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faster clocks for synthesis (not changing actual freq)

Krzysztof Skrzynecki 1 周之前
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      projects/riscv_usb/data/clocks.py

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projects/riscv_usb/data/clocks.py

@@ -1,2 +1,2 @@
-ctx.addClock("clk_24m", 24)
-ctx.addClock("clk_48m", 48)
+ctx.addClock("clk_24m", 25)
+ctx.addClock("clk_48m", 100)