Commit Verlauf

Autor SHA1 Nachricht Datum
  Sylvain Munaut 668a2e3606 build: Update build logic to prepare for split and out-of-tree build vor 4 Jahren
  Sylvain Munaut 7e3d71c421 build: Use "relative" path for the include of all the deps vor 4 Jahren
  Sylvain Munaut 019122035b cores/misc: Improve uniformity between pdm and pwm vor 4 Jahren
  Sylvain Munaut cef5cb69fa projects/riscv_usb: Add support for e1tracer,ice1usb,icepick boards vor 4 Jahren
  Sylvain Munaut 1d57cbe16f projects/boot_stub: Add support for special Vio feature of some board vor 4 Jahren
  Sylvain Munaut 4aafd09833 projects/boot_stub: Add support for a few other boards vor 4 Jahren
  Sylvain Munaut c22180302c projects/boot_stub: Make a lot of things optional / board dependent vor 4 Jahren
  Sylvain Munaut 8027676f21 projects/boot_stub: Use HF_OSC as clock source vor 4 Jahren
  Sylvain Munaut 1cdde8f8ea projects/boot_stub: Add target to easily build bootloader vor 4 Jahren
  Sylvain Munaut 8b0bebfde2 projects/riscv_usb: Add custom vendor commands in DFU firmware vor 5 Jahren
  Sylvain Munaut acbdbcccd3 projects/riscv_usb: Add Makefile target to program app via DFU vor 5 Jahren
  Sylvain Munaut a3065f1629 projects/riscv_usb: Import DFU firmware vor 5 Jahren
  Sylvain Munaut 92c03a9355 projects/riscv_usb: Update Makefile with new bootcode targets vor 5 Jahren
  Sylvain Munaut f69146d035 projects/riscv_usb: Update fw/ gitignore vor 5 Jahren
  Sylvain Munaut 8cc8acfb36 projects/riscv_usb: Complete overhaul of the USB stack vor 5 Jahren
  Sylvain Munaut 0eec262a74 projects/riscv_usb: Add nano.specs in the CFLAGS vor 5 Jahren
  Sylvain Munaut cb358304ff projects/riscv_usb: Adapt to allow 64k/128k of SPRAM vor 5 Jahren
  Sylvain Munaut c80f0a9f67 cores/mem_cache: Improvement on the memory simulator vor 4 Jahren
  Sylvain Munaut 3bd5ca1a5f cores/mem_cache: Initial import of iCE40 memory cache vor 5 Jahren
  Sylvain Munaut 7c7e120a84 projects: Update constraints for bitsy v0 and v1 vor 4 Jahren
  Sylvain Munaut c1483f3018 projects/riscv_usb: Update BOARD define for C source to match verilog one vor 4 Jahren
  Sylvain Munaut c138c61984 cores/e1: Add option to use an external LIU instead of the iCE40 as PHY vor 5 Jahren
  Sylvain Munaut f147c005db cores/e1: Minor synth improvement on CRC core vor 5 Jahren
  Sylvain Munaut 21300d8cfe cores/e1: Fix CRC error marker in BD out fifo vor 5 Jahren
  Sylvain Munaut f8b05c3630 cores/e1: Still generate TS0 pattern in case of underruns. vor 5 Jahren
  Sylvain Munaut e51318fa05 cores/e1: Export tick for TX and RX path vor 5 Jahren
  Sylvain Munaut 96e0348be9 cores/e1: Import register level documentation vor 5 Jahren
  Sylvain Munaut effdabf3cd cores/e1: Import E1 core vor 5 Jahren
  Sylvain Munaut 12891bcfc7 projects/memtest: Add missing PCF file for icebreaker vor 4 Jahren
  Sylvain Munaut 3e030f46ee cores/qspi_master: Prevent yosys from using a bram for 16-element ROM vor 4 Jahren