Historial de Commits

Autor SHA1 Mensaje Fecha
  Sylvain Munaut d48b63777c projects/riscv_usb: Add missing () in constant init hace 5 años
  Sylvain Munaut 9e815d5bb4 projects/riscv_usb: Fixup command prompt hace 5 años
  Sylvain Munaut b9622164c0 projects/riscv_usb: Add optional register stages in PicoRV -> WB bridge hace 5 años
  Sylvain Munaut 6f6311c8fb projects/riscv_usb: Add support for write mask to WB bus hace 5 años
  Sylvain Munaut b8f69663c9 cores/usb: Fix microcode when waiting for a BCI Ack hace 5 años
  Sylvain Munaut fe836cb2d0 cores/usb: Remove register in the CSR read data path hace 5 años
  Sylvain Munaut bda118d74b projects/riscv_usb: Major firmware rework/refactoring hace 5 años
  Sylvain Munaut f6d2bbabfd projects/riscv_usb: Fix UART divisor off-by-one hace 5 años
  Sylvain Munaut 3fd3e6bec1 projects/riscv_usb: Improve firmware size by turning on LTO hace 5 años
  Sylvain Munaut d65510a81d cores/usb: Output a Start-Of-Frame strobe hace 5 años
  Sylvain Munaut af7a3a57d6 cores/usb: Rework CSR mapping and way events are reported hace 5 años
  Sylvain Munaut 644f89fb59 cores/usb: Minor cosmetic fix in documentation hace 5 años
  Sylvain Munaut b3c22011be cores/usb: Remove the bus MSB matching hace 5 años
  Sylvain Munaut 19946330f7 cores/usb: Add brief documentation for the microcode op codes hace 5 años
  Sylvain Munaut 5e7d05e3e7 cores/misc: Fix uart_wb handling of full fifo hace 5 años
  Sylvain Munaut 57373928b0 cores/misc: Import simple PDM core (pulse density modulation) hace 5 años
  Sylvain Munaut 015dea82ef build: Define symbol matching the board config being built hace 6 años
  Sylvain Munaut 9cf400b9ad projects/riscv_usb: Import RISCV + USB prototype hace 6 años
  Sylvain Munaut 6b8188125c cores/usb: Add debug option to the microcode compiler hace 6 años
  Sylvain Munaut 5b63e8251c cores/usb: Remove debug output hace 6 años
  Sylvain Munaut 12d9e46ab0 cores/usb: Add Control Endpoint Lockout feature hace 6 años
  Sylvain Munaut 5229fb7590 cores/usb: Add special buffer descriptor mode for control endpoint hace 6 años
  Sylvain Munaut ea06e6878b cores/usb: Fix RX bit stuffing implementation hace 6 años
  Sylvain Munaut aff3b98e7a cores/usb: Import current state of the USB core hace 6 años
  Sylvain Munaut 2e0e25b76f cores/misc: Add cross-clock wishbone interface hace 6 años
  Sylvain Munaut 6067f61535 cores/misc: Add cross-clock strobe hace 6 años
  Sylvain Munaut 22c3e9a4ee cores/misc: Add UART with wishbone & FIFO hace 6 años
  Sylvain Munaut 2ed6b32cf4 cores/misc: Add simple UART TX/RX cores hace 6 años
  Sylvain Munaut 9e01a6a390 cores/video: Change the color lookup algo for direct mode hace 6 años
  Sylvain Munaut 68ac87f6c4 Update the vim modeline to be closer to top of file hace 6 años