riscv_doom.json 7.0 MB

123456789101112131415161718192021222324252627282930313233343536373839404142434445464748495051525354555657585960616263646566676869707172737475767778798081828384858687888990919293949596979899100101102103104105106107108109110111112113114115116117118119120121122123124125126127128129130131132133134135136137138139140141142143144145146147148149150151152153154155156157158159160161162163164165166167168169170171172173174175176177178179180181182183184185186187188189190191192193194195196197198199200201202203204205206207208209210211212213214215216217218219220221222223224225226227228229230231232233234235236237238239240241242243244245246247248249250251252253254255256257258259260261262263264265266267268269270271272273274275276277278279280281282283284285286287288289290291292293294295296297298299300301302303304305306307308309310311312313314315316317318319320321322323324325326327328329330331332333334335336337338339340341342343344345346347348349350351352353354355356357358359360361362363364365366367368369370371372373374375376377378379380381382383384385386387388389390391392393394395396397398399400401402403404405406407408409410411412413414415416417418419420421422423424425426427428429430431432433434435436437438439440441442443444445446447448449450451452453454455456457458459460461462463464465466467468469470471472473474475476477478479480481482483484485486487488489490491492493494495496497498499500501502503504505506507508509510511512513514515516517518519520521522523524525526527528529530531532533534535536537538539540541542543544545546547548549550551552553554555556557558559560561562563564565566567568569570571572573574575576577578579580581582583584585586587588589590591592593594595596597598599600601602603604605606607608609610611612613614615616617618619620621622623624625626627628629630631632633634635636637638639640641642643644645646647648649650651652653654655656657658659660661662663664665666667668669670671672673674675676677678679680681682683684685686687688689690691692693694695696697698699700701702703704705706707708709710711712713714715716717718719720721722723724725726727728729730731732733734735736737738739740741742743744745746747748749750751752753754755756757758759760761762763764765766767768769770771772773774775776777778779780781782783784785786787788789790791792793794795796797798799800801802803804805806807808809810811812813814815816817818819820821822823824825826827828829830831832833834835836837838839840841842843844845846847848849850851852853854855856857858859860861862863864865866867868869870871872873874875876877878879880881882883884885886887888889890891892893894895896897898899900901902903904905906907908909910911912913914915916917918919920921922923924925926927928929930931932933934935936937938939940941942943944945946947948949950951952953954955956957958959960961962963964965966967968969970971972973974975976977978979980981982983984985986987988989990991992993994995996997998999100010011002100310041005100610071008100910101011101210131014101510161017101810191020102110221023102410251026102710281029103010311032103310341035103610371038103910401041104210431044104510461047104810491050105110521053105410551056105710581059106010611062106310641065106610671068106910701071107210731074107510761077107810791080108110821083108410851086108710881089109010911092109310941095109610971098109911001101110211031104110511061107110811091110111111121113111411151116111711181119112011211122112311241125112611271128112911301131113211331134113511361137113811391140114111421143114411451146114711481149115011511152115311541155115611571158115911601161116211631164116511661167116811691170117111721173117411751176117711781179118011811182118311841185118611871188118911901191119211931194119511961197119811991200120112021203120412051206120712081209121012111212121312141215121612171218121912201221122212231224122512261227122812291230123112321233123412351236123712381239124012411242124312441245124612471248124912501251125212531254125512561257125812591260126112621263126412651266126712681269127012711272127312741275127612771278127912801281128212831284128512861287128812891290129112921293129412951296129712981299130013011302130313041305130613071308130913101311131213131314131513161317131813191320132113221323132413251326132713281329133013311332133313341335133613371338133913401341134213431344134513461347134813491350135113521353135413551356135713581359136013611362136313641365136613671368136913701371137213731374137513761377137813791380138113821383138413851386138713881389139013911392139313941395139613971398139914001401140214031404140514061407140814091410141114121413141414151416141714181419142014211422142314241425142614271428142914301431143214331434143514361437143814391440144114421443144414451446144714481449145014511452145314541455145614571458145914601461146214631464146514661467146814691470147114721473147414751476147714781479148014811482148314841485148614871488148914901491149214931494149514961497149814991500150115021503150415051506150715081509151015111512151315141515151615171518151915201521152215231524152515261527152815291530153115321533153415351536153715381539154015411542154315441545154615471548154915501551155215531554155515561557155815591560156115621563156415651566156715681569157015711572157315741575157615771578157915801581158215831584158515861587158815891590159115921593159415951596159715981599160016011602160316041605160616071608160916101611161216131614161516161617161816191620162116221623162416251626162716281629163016311632163316341635163616371638163916401641164216431644164516461647164816491650165116521653165416551656165716581659166016611662166316641665166616671668166916701671167216731674167516761677167816791680168116821683168416851686168716881689169016911692169316941695169616971698169917001701170217031704170517061707170817091710171117121713171417151716171717181719172017211722172317241725172617271728172917301731173217331734173517361737173817391740174117421743174417451746174717481749175017511752175317541755175617571758175917601761176217631764176517661767176817691770177117721773177417751776177717781779178017811782178317841785178617871788178917901791179217931794179517961797179817991800180118021803180418051806180718081809181018111812181318141815181618171818181918201821182218231824182518261827182818291830183118321833183418351836183718381839184018411842184318441845184618471848184918501851185218531854185518561857185818591860186118621863186418651866186718681869187018711872187318741875187618771878187918801881188218831884188518861887188818891890189118921893189418951896189718981899190019011902190319041905190619071908190919101911191219131914191519161917191819191920192119221923192419251926192719281929193019311932193319341935193619371938193919401941194219431944194519461947194819491950195119521953195419551956195719581959196019611962196319641965196619671968196919701971197219731974197519761977197819791980198119821983198419851986198719881989199019911992199319941995199619971998199920002001200220032004200520062007200820092010201120122013201420152016201720182019202020212022202320242025202620272028202920302031203220332034203520362037203820392040204120422043204420452046204720482049205020512052205320542055205620572058205920602061206220632064206520662067206820692070207120722073207420752076207720782079208020812082208320842085208620872088208920902091209220932094209520962097209820992100210121022103210421052106210721082109211021112112211321142115211621172118211921202121212221232124212521262127212821292130213121322133213421352136213721382139214021412142214321442145214621472148214921502151215221532154215521562157215821592160216121622163216421652166216721682169217021712172217321742175217621772178217921802181218221832184218521862187218821892190219121922193219421952196219721982199220022012202220322042205220622072208220922102211221222132214221522162217221822192220222122222223222422252226222722282229223022312232223322342235223622372238223922402241224222432244224522462247224822492250225122522253225422552256225722582259226022612262226322642265226622672268226922702271227222732274227522762277227822792280228122822283228422852286228722882289229022912292229322942295229622972298229923002301230223032304230523062307230823092310231123122313231423152316231723182319232023212322232323242325232623272328232923302331233223332334233523362337233823392340234123422343234423452346234723482349235023512352235323542355235623572358235923602361236223632364236523662367236823692370237123722373237423752376237723782379238023812382238323842385238623872388238923902391239223932394239523962397239823992400240124022403240424052406240724082409241024112412241324142415241624172418241924202421242224232424242524262427242824292430243124322433243424352436243724382439244024412442244324442445244624472448244924502451245224532454245524562457245824592460246124622463246424652466246724682469247024712472247324742475247624772478247924802481248224832484248524862487248824892490249124922493249424952496249724982499250025012502250325042505250625072508250925102511251225132514251525162517251825192520252125222523252425252526252725282529253025312532253325342535253625372538253925402541254225432544254525462547254825492550255125522553255425552556255725582559256025612562256325642565256625672568256925702571257225732574257525762577257825792580258125822583258425852586258725882589259025912592259325942595259625972598259926002601260226032604260526062607260826092610261126122613261426152616261726182619262026212622262326242625262626272628262926302631263226332634263526362637263826392640264126422643264426452646264726482649265026512652265326542655265626572658265926602661266226632664266526662667266826692670267126722673267426752676267726782679268026812682268326842685268626872688268926902691269226932694269526962697269826992700270127022703270427052706270727082709271027112712271327142715271627172718271927202721272227232724272527262727272827292730273127322733273427352736273727382739274027412742274327442745274627472748274927502751275227532754275527562757275827592760276127622763276427652766276727682769277027712772277327742775277627772778277927802781278227832784278527862787278827892790279127922793279427952796279727982799280028012802280328042805280628072808280928102811281228132814281528162817281828192820282128222823282428252826282728282829283028312832283328342835283628372838283928402841284228432844284528462847284828492850285128522853285428552856285728582859286028612862286328642865286628672868286928702871287228732874287528762877287828792880288128822883288428852886288728882889289028912892289328942895289628972898289929002901290229032904290529062907290829092910291129122913291429152916291729182919292029212922292329242925292629272928292929302931293229332934293529362937293829392940294129422943294429452946294729482949295029512952295329542955295629572958295929602961296229632964296529662967296829692970297129722973297429752976297729782979298029812982298329842985298629872988298929902991299229932994299529962997299829993000300130023003300430053006300730083009301030113012301330143015301630173018301930203021302230233024302530263027302830293030303130323033303430353036303730383039304030413042304330443045304630473048304930503051305230533054305530563057305830593060306130623063306430653066306730683069307030713072307330743075307630773078307930803081308230833084308530863087308830893090309130923093309430953096309730983099310031013102310331043105310631073108310931103111311231133114311531163117311831193120312131223123312431253126312731283129313031313132313331343135313631373138313931403141314231433144314531463147314831493150315131523153315431553156315731583159316031613162316331643165316631673168316931703171317231733174317531763177317831793180318131823183318431853186318731883189319031913192319331943195319631973198319932003201320232033204320532063207320832093210321132123213321432153216321732183219322032213222322332243225322632273228322932303231323232333234323532363237323832393240324132423243324432453246324732483249325032513252325332543255325632573258325932603261326232633264326532663267326832693270327132723273327432753276327732783279328032813282328332843285328632873288328932903291329232933294329532963297329832993300330133023303330433053306330733083309331033113312331333143315331633173318331933203321332233233324332533263327332833293330333133323333333433353336333733383339334033413342334333443345334633473348334933503351335233533354335533563357335833593360336133623363336433653366336733683369337033713372337333743375337633773378337933803381338233833384338533863387338833893390339133923393339433953396339733983399340034013402340334043405340634073408340934103411341234133414341534163417341834193420342134223423342434253426342734283429343034313432343334343435343634373438343934403441344234433444344534463447344834493450345134523453345434553456345734583459346034613462346334643465346634673468346934703471347234733474347534763477347834793480348134823483348434853486348734883489349034913492349334943495349634973498349935003501350235033504350535063507350835093510351135123513351435153516351735183519352035213522352335243525352635273528352935303531353235333534353535363537353835393540354135423543354435453546354735483549355035513552355335543555355635573558355935603561356235633564356535663567356835693570357135723573357435753576357735783579358035813582358335843585358635873588358935903591359235933594359535963597359835993600360136023603360436053606360736083609361036113612361336143615361636173618361936203621362236233624362536263627362836293630363136323633363436353636363736383639364036413642364336443645364636473648364936503651365236533654365536563657365836593660366136623663366436653666366736683669367036713672367336743675367636773678367936803681368236833684368536863687368836893690369136923693369436953696369736983699370037013702370337043705370637073708370937103711371237133714371537163717371837193720372137223723372437253726372737283729373037313732373337343735373637373738373937403741374237433744374537463747374837493750375137523753375437553756375737583759376037613762376337643765376637673768376937703771377237733774377537763777377837793780378137823783378437853786378737883789379037913792379337943795379637973798379938003801380238033804380538063807380838093810381138123813381438153816381738183819382038213822382338243825382638273828382938303831383238333834383538363837383838393840384138423843384438453846384738483849385038513852385338543855385638573858385938603861386238633864386538663867386838693870387138723873387438753876387738783879388038813882388338843885388638873888388938903891389238933894389538963897389838993900390139023903390439053906390739083909391039113912391339143915391639173918391939203921392239233924392539263927392839293930393139323933393439353936393739383939394039413942394339443945394639473948394939503951395239533954395539563957395839593960396139623963396439653966396739683969397039713972397339743975397639773978397939803981398239833984398539863987398839893990399139923993399439953996399739983999400040014002400340044005400640074008400940104011401240134014401540164017401840194020402140224023402440254026402740284029403040314032403340344035403640374038403940404041404240434044404540464047404840494050405140524053405440554056405740584059406040614062406340644065406640674068406940704071407240734074407540764077407840794080408140824083408440854086408740884089409040914092409340944095409640974098409941004101410241034104410541064107410841094110411141124113411441154116411741184119412041214122412341244125412641274128412941304131413241334134413541364137413841394140414141424143414441454146414741484149415041514152415341544155415641574158415941604161416241634164416541664167416841694170417141724173417441754176417741784179418041814182418341844185418641874188418941904191419241934194419541964197419841994200420142024203420442054206420742084209421042114212421342144215421642174218421942204221422242234224422542264227422842294230423142324233423442354236423742384239424042414242424342444245424642474248424942504251425242534254425542564257425842594260426142624263426442654266426742684269427042714272427342744275427642774278427942804281428242834284428542864287428842894290429142924293429442954296429742984299430043014302430343044305430643074308430943104311431243134314431543164317431843194320432143224323432443254326432743284329433043314332433343344335433643374338433943404341434243434344434543464347434843494350435143524353435443554356435743584359436043614362436343644365436643674368436943704371437243734374437543764377437843794380438143824383438443854386438743884389439043914392439343944395439643974398439944004401440244034404440544064407440844094410441144124413441444154416441744184419442044214422442344244425442644274428442944304431443244334434443544364437443844394440444144424443444444454446444744484449445044514452445344544455445644574458445944604461446244634464446544664467446844694470447144724473447444754476447744784479448044814482448344844485448644874488448944904491449244934494449544964497449844994500450145024503450445054506450745084509451045114512451345144515451645174518451945204521452245234524452545264527452845294530453145324533453445354536453745384539454045414542454345444545454645474548454945504551455245534554455545564557455845594560456145624563456445654566456745684569457045714572457345744575457645774578457945804581458245834584458545864587458845894590459145924593459445954596459745984599460046014602460346044605460646074608460946104611461246134614461546164617461846194620462146224623462446254626462746284629463046314632463346344635463646374638463946404641464246434644464546464647464846494650465146524653465446554656465746584659466046614662466346644665466646674668466946704671467246734674467546764677467846794680468146824683468446854686468746884689469046914692469346944695469646974698469947004701470247034704470547064707470847094710471147124713471447154716471747184719472047214722472347244725472647274728472947304731473247334734473547364737473847394740474147424743474447454746474747484749475047514752475347544755475647574758475947604761476247634764476547664767476847694770477147724773477447754776477747784779478047814782478347844785478647874788478947904791479247934794479547964797479847994800480148024803480448054806480748084809481048114812481348144815481648174818481948204821482248234824482548264827482848294830483148324833483448354836483748384839484048414842484348444845484648474848484948504851485248534854485548564857485848594860486148624863486448654866486748684869487048714872487348744875487648774878487948804881488248834884488548864887488848894890489148924893489448954896489748984899490049014902490349044905490649074908490949104911491249134914491549164917491849194920492149224923492449254926492749284929493049314932493349344935493649374938493949404941494249434944494549464947494849494950495149524953495449554956495749584959496049614962496349644965496649674968496949704971497249734974497549764977497849794980498149824983498449854986498749884989499049914992499349944995499649974998499950005001500250035004500550065007500850095010501150125013501450155016501750185019502050215022502350245025502650275028502950305031503250335034503550365037503850395040504150425043504450455046504750485049505050515052505350545055505650575058505950605061506250635064506550665067506850695070507150725073507450755076507750785079508050815082508350845085508650875088508950905091509250935094509550965097509850995100510151025103510451055106510751085109511051115112511351145115511651175118511951205121512251235124512551265127512851295130513151325133513451355136513751385139514051415142514351445145514651475148514951505151515251535154515551565157515851595160516151625163516451655166516751685169517051715172517351745175517651775178517951805181518251835184518551865187518851895190519151925193519451955196519751985199520052015202520352045205520652075208520952105211521252135214521552165217521852195220522152225223522452255226522752285229523052315232523352345235523652375238523952405241524252435244524552465247524852495250525152525253525452555256525752585259526052615262526352645265526652675268526952705271527252735274527552765277527852795280528152825283528452855286528752885289529052915292529352945295529652975298529953005301530253035304530553065307530853095310531153125313531453155316531753185319532053215322532353245325532653275328532953305331533253335334533553365337533853395340534153425343534453455346534753485349535053515352535353545355535653575358535953605361536253635364536553665367536853695370537153725373537453755376537753785379538053815382538353845385538653875388538953905391539253935394539553965397539853995400540154025403540454055406540754085409541054115412541354145415541654175418541954205421542254235424542554265427542854295430543154325433543454355436543754385439544054415442544354445445544654475448544954505451545254535454545554565457545854595460546154625463546454655466546754685469547054715472547354745475547654775478547954805481548254835484548554865487548854895490549154925493549454955496549754985499550055015502550355045505550655075508550955105511551255135514551555165517551855195520552155225523552455255526552755285529553055315532553355345535553655375538553955405541554255435544554555465547554855495550555155525553555455555556555755585559556055615562556355645565556655675568556955705571557255735574557555765577557855795580558155825583558455855586558755885589559055915592559355945595559655975598559956005601560256035604560556065607560856095610561156125613561456155616561756185619562056215622562356245625562656275628562956305631563256335634563556365637563856395640564156425643564456455646564756485649565056515652565356545655565656575658565956605661566256635664566556665667566856695670567156725673567456755676567756785679568056815682568356845685568656875688568956905691569256935694569556965697569856995700570157025703570457055706570757085709571057115712571357145715571657175718571957205721572257235724572557265727572857295730573157325733573457355736573757385739574057415742574357445745574657475748574957505751575257535754575557565757575857595760576157625763576457655766576757685769577057715772577357745775577657775778577957805781578257835784578557865787578857895790579157925793579457955796579757985799580058015802580358045805580658075808580958105811581258135814581558165817581858195820582158225823582458255826582758285829583058315832583358345835583658375838583958405841584258435844584558465847584858495850585158525853585458555856585758585859586058615862586358645865586658675868586958705871587258735874587558765877587858795880588158825883588458855886588758885889589058915892589358945895589658975898589959005901590259035904590559065907590859095910591159125913591459155916591759185919592059215922592359245925592659275928592959305931593259335934593559365937593859395940594159425943594459455946594759485949595059515952595359545955595659575958595959605961596259635964596559665967596859695970597159725973597459755976597759785979598059815982598359845985598659875988598959905991599259935994599559965997599859996000600160026003600460056006600760086009601060116012601360146015601660176018601960206021602260236024602560266027602860296030603160326033603460356036603760386039604060416042604360446045604660476048604960506051605260536054605560566057605860596060606160626063606460656066606760686069607060716072607360746075607660776078607960806081608260836084608560866087608860896090609160926093609460956096609760986099610061016102610361046105610661076108610961106111611261136114611561166117611861196120612161226123612461256126612761286129613061316132613361346135613661376138613961406141614261436144614561466147614861496150615161526153615461556156615761586159616061616162616361646165616661676168616961706171617261736174617561766177617861796180618161826183618461856186618761886189619061916192619361946195619661976198619962006201620262036204620562066207620862096210621162126213621462156216621762186219622062216222622362246225622662276228622962306231623262336234623562366237623862396240624162426243624462456246624762486249625062516252625362546255625662576258625962606261626262636264626562666267626862696270627162726273627462756276627762786279628062816282628362846285628662876288628962906291629262936294629562966297629862996300630163026303630463056306630763086309631063116312631363146315631663176318631963206321632263236324632563266327632863296330633163326333633463356336633763386339634063416342634363446345634663476348634963506351635263536354635563566357635863596360636163626363636463656366636763686369637063716372637363746375637663776378637963806381638263836384638563866387638863896390639163926393639463956396639763986399640064016402640364046405640664076408640964106411641264136414641564166417641864196420642164226423642464256426642764286429643064316432643364346435643664376438643964406441644264436444644564466447644864496450645164526453645464556456645764586459646064616462646364646465646664676468646964706471647264736474647564766477647864796480648164826483648464856486648764886489649064916492649364946495649664976498649965006501650265036504650565066507650865096510651165126513651465156516651765186519652065216522652365246525652665276528652965306531653265336534653565366537653865396540654165426543654465456546654765486549655065516552655365546555655665576558655965606561656265636564656565666567656865696570657165726573657465756576657765786579658065816582658365846585658665876588658965906591659265936594659565966597659865996600660166026603660466056606660766086609661066116612661366146615661666176618661966206621662266236624662566266627662866296630663166326633663466356636663766386639664066416642664366446645664666476648664966506651665266536654665566566657665866596660666166626663666466656666666766686669667066716672667366746675667666776678667966806681668266836684668566866687668866896690669166926693669466956696669766986699670067016702670367046705670667076708670967106711671267136714671567166717671867196720672167226723672467256726672767286729673067316732673367346735673667376738673967406741674267436744674567466747674867496750675167526753675467556756675767586759676067616762676367646765676667676768676967706771677267736774677567766777677867796780678167826783678467856786678767886789679067916792679367946795679667976798679968006801680268036804680568066807680868096810681168126813681468156816681768186819682068216822682368246825682668276828682968306831683268336834683568366837683868396840684168426843684468456846684768486849685068516852685368546855685668576858685968606861686268636864686568666867686868696870687168726873687468756876687768786879688068816882688368846885688668876888688968906891689268936894689568966897689868996900690169026903690469056906690769086909691069116912691369146915691669176918691969206921692269236924692569266927692869296930693169326933693469356936693769386939694069416942694369446945694669476948694969506951695269536954695569566957695869596960696169626963696469656966696769686969697069716972697369746975697669776978697969806981698269836984698569866987698869896990699169926993699469956996699769986999700070017002700370047005700670077008700970107011701270137014701570167017701870197020702170227023702470257026702770287029703070317032703370347035703670377038703970407041704270437044704570467047704870497050705170527053705470557056705770587059706070617062706370647065706670677068706970707071707270737074707570767077707870797080708170827083708470857086708770887089709070917092709370947095709670977098709971007101710271037104710571067107710871097110711171127113711471157116711771187119712071217122712371247125712671277128712971307131713271337134713571367137713871397140714171427143714471457146714771487149715071517152715371547155715671577158715971607161716271637164716571667167716871697170717171727173717471757176717771787179718071817182718371847185718671877188718971907191719271937194719571967197719871997200720172027203720472057206720772087209721072117212721372147215721672177218721972207221722272237224722572267227722872297230723172327233723472357236723772387239724072417242724372447245724672477248724972507251725272537254725572567257725872597260726172627263726472657266726772687269727072717272727372747275727672777278727972807281728272837284728572867287728872897290729172927293729472957296729772987299730073017302730373047305730673077308730973107311731273137314731573167317731873197320732173227323732473257326732773287329733073317332733373347335733673377338733973407341734273437344734573467347734873497350735173527353735473557356735773587359736073617362736373647365736673677368736973707371737273737374737573767377737873797380738173827383738473857386738773887389739073917392739373947395739673977398739974007401740274037404740574067407740874097410741174127413741474157416741774187419742074217422742374247425742674277428742974307431743274337434743574367437743874397440744174427443744474457446744774487449745074517452745374547455745674577458745974607461746274637464746574667467746874697470747174727473747474757476747774787479748074817482748374847485748674877488748974907491749274937494749574967497749874997500750175027503750475057506750775087509751075117512751375147515751675177518751975207521752275237524752575267527752875297530753175327533753475357536753775387539754075417542754375447545754675477548754975507551755275537554755575567557755875597560756175627563756475657566756775687569757075717572757375747575757675777578757975807581758275837584758575867587758875897590759175927593759475957596759775987599760076017602760376047605760676077608760976107611761276137614761576167617761876197620762176227623762476257626762776287629763076317632763376347635763676377638763976407641764276437644764576467647764876497650765176527653765476557656765776587659766076617662766376647665766676677668766976707671767276737674767576767677767876797680768176827683768476857686768776887689769076917692769376947695769676977698769977007701770277037704770577067707770877097710771177127713771477157716771777187719772077217722772377247725772677277728772977307731773277337734773577367737773877397740774177427743774477457746774777487749775077517752775377547755775677577758775977607761776277637764776577667767776877697770777177727773777477757776777777787779778077817782778377847785778677877788778977907791779277937794779577967797779877997800780178027803780478057806780778087809781078117812781378147815781678177818781978207821782278237824782578267827782878297830783178327833783478357836783778387839784078417842784378447845784678477848784978507851785278537854785578567857785878597860786178627863786478657866786778687869787078717872787378747875787678777878787978807881788278837884788578867887788878897890789178927893789478957896789778987899790079017902790379047905790679077908790979107911791279137914791579167917791879197920792179227923792479257926792779287929793079317932793379347935793679377938793979407941794279437944794579467947794879497950795179527953795479557956795779587959796079617962796379647965796679677968796979707971797279737974797579767977797879797980798179827983798479857986798779887989799079917992799379947995799679977998799980008001800280038004800580068007800880098010801180128013801480158016801780188019802080218022802380248025802680278028802980308031803280338034803580368037803880398040804180428043804480458046804780488049805080518052805380548055805680578058805980608061806280638064806580668067806880698070807180728073807480758076807780788079808080818082808380848085808680878088808980908091809280938094809580968097809880998100810181028103810481058106810781088109811081118112811381148115811681178118811981208121812281238124812581268127812881298130813181328133813481358136813781388139814081418142814381448145814681478148814981508151815281538154815581568157815881598160816181628163816481658166816781688169817081718172817381748175817681778178817981808181818281838184818581868187818881898190819181928193819481958196819781988199820082018202820382048205820682078208820982108211821282138214821582168217821882198220822182228223822482258226822782288229823082318232823382348235823682378238823982408241824282438244824582468247824882498250825182528253825482558256825782588259826082618262826382648265826682678268826982708271827282738274827582768277827882798280828182828283828482858286828782888289829082918292829382948295829682978298829983008301830283038304830583068307830883098310831183128313831483158316831783188319832083218322832383248325832683278328832983308331833283338334833583368337833883398340834183428343834483458346834783488349835083518352835383548355835683578358835983608361836283638364836583668367836883698370837183728373837483758376837783788379838083818382838383848385838683878388838983908391839283938394839583968397839883998400840184028403840484058406840784088409841084118412841384148415841684178418841984208421842284238424842584268427842884298430843184328433843484358436843784388439844084418442844384448445844684478448844984508451845284538454845584568457845884598460846184628463846484658466846784688469847084718472847384748475847684778478847984808481848284838484848584868487848884898490849184928493849484958496849784988499850085018502850385048505850685078508850985108511851285138514851585168517851885198520852185228523852485258526852785288529853085318532853385348535853685378538853985408541854285438544854585468547854885498550855185528553855485558556855785588559856085618562856385648565856685678568856985708571857285738574857585768577857885798580858185828583858485858586858785888589859085918592859385948595859685978598859986008601860286038604860586068607860886098610861186128613861486158616861786188619862086218622862386248625862686278628862986308631863286338634863586368637863886398640864186428643864486458646864786488649865086518652865386548655865686578658865986608661866286638664866586668667866886698670867186728673867486758676867786788679868086818682868386848685868686878688868986908691869286938694869586968697869886998700870187028703870487058706870787088709871087118712871387148715871687178718871987208721872287238724872587268727872887298730873187328733873487358736873787388739874087418742874387448745874687478748874987508751875287538754875587568757875887598760876187628763876487658766876787688769877087718772877387748775877687778778877987808781878287838784878587868787878887898790879187928793879487958796879787988799880088018802880388048805880688078808880988108811881288138814881588168817881888198820882188228823882488258826882788288829883088318832883388348835883688378838883988408841884288438844884588468847884888498850885188528853885488558856885788588859886088618862886388648865886688678868886988708871887288738874887588768877887888798880888188828883888488858886888788888889889088918892889388948895889688978898889989008901890289038904890589068907890889098910891189128913891489158916891789188919892089218922892389248925892689278928892989308931893289338934893589368937893889398940894189428943894489458946894789488949895089518952895389548955895689578958895989608961896289638964896589668967896889698970897189728973897489758976897789788979898089818982898389848985898689878988898989908991899289938994899589968997899889999000900190029003900490059006900790089009901090119012901390149015901690179018901990209021902290239024902590269027902890299030903190329033903490359036903790389039904090419042904390449045904690479048904990509051905290539054905590569057905890599060906190629063906490659066906790689069907090719072907390749075907690779078907990809081908290839084908590869087908890899090909190929093909490959096909790989099910091019102910391049105910691079108910991109111911291139114911591169117911891199120912191229123912491259126912791289129913091319132913391349135913691379138913991409141914291439144914591469147914891499150915191529153915491559156915791589159916091619162916391649165916691679168916991709171917291739174917591769177917891799180918191829183918491859186918791889189919091919192919391949195919691979198919992009201920292039204920592069207920892099210921192129213921492159216921792189219922092219222922392249225922692279228922992309231923292339234923592369237923892399240924192429243924492459246924792489249925092519252925392549255925692579258925992609261926292639264926592669267926892699270927192729273927492759276927792789279928092819282928392849285928692879288928992909291929292939294929592969297929892999300930193029303930493059306930793089309931093119312931393149315931693179318931993209321932293239324932593269327932893299330933193329333933493359336933793389339934093419342934393449345934693479348934993509351935293539354935593569357935893599360936193629363936493659366936793689369937093719372937393749375937693779378937993809381938293839384938593869387938893899390939193929393939493959396939793989399940094019402940394049405940694079408940994109411941294139414941594169417941894199420942194229423942494259426942794289429943094319432943394349435943694379438943994409441944294439444944594469447944894499450945194529453945494559456945794589459946094619462946394649465946694679468946994709471947294739474947594769477947894799480948194829483948494859486948794889489949094919492949394949495949694979498949995009501950295039504950595069507950895099510951195129513951495159516951795189519952095219522952395249525952695279528952995309531953295339534953595369537953895399540954195429543954495459546954795489549955095519552955395549555955695579558955995609561956295639564956595669567956895699570957195729573957495759576957795789579958095819582958395849585958695879588958995909591959295939594959595969597959895999600960196029603960496059606960796089609961096119612961396149615961696179618961996209621962296239624962596269627962896299630963196329633963496359636963796389639964096419642964396449645964696479648964996509651965296539654965596569657965896599660966196629663966496659666966796689669967096719672967396749675967696779678967996809681968296839684968596869687968896899690969196929693969496959696969796989699970097019702970397049705970697079708970997109711971297139714971597169717971897199720972197229723972497259726972797289729973097319732973397349735973697379738973997409741974297439744974597469747974897499750975197529753975497559756975797589759976097619762976397649765976697679768976997709771977297739774977597769777977897799780978197829783978497859786978797889789979097919792979397949795979697979798979998009801980298039804980598069807980898099810981198129813981498159816981798189819982098219822982398249825982698279828982998309831983298339834983598369837983898399840984198429843984498459846984798489849985098519852985398549855985698579858985998609861986298639864986598669867986898699870987198729873987498759876987798789879988098819882988398849885988698879888988998909891989298939894989598969897989898999900990199029903990499059906990799089909991099119912991399149915991699179918991999209921992299239924992599269927992899299930993199329933993499359936993799389939994099419942994399449945994699479948994999509951995299539954995599569957995899599960996199629963996499659966996799689969997099719972997399749975997699779978997999809981998299839984998599869987998899899990999199929993999499959996999799989999100001000110002100031000410005100061000710008100091001010011100121001310014100151001610017100181001910020100211002210023100241002510026100271002810029100301003110032100331003410035100361003710038100391004010041100421004310044100451004610047100481004910050100511005210053100541005510056100571005810059100601006110062100631006410065100661006710068100691007010071100721007310074100751007610077100781007910080100811008210083100841008510086100871008810089100901009110092100931009410095100961009710098100991010010101101021010310104101051010610107101081010910110101111011210113101141011510116101171011810119101201012110122101231012410125101261012710128101291013010131101321013310134101351013610137101381013910140101411014210143101441014510146101471014810149101501015110152101531015410155101561015710158101591016010161101621016310164101651016610167101681016910170101711017210173101741017510176101771017810179101801018110182101831018410185101861018710188101891019010191101921019310194101951019610197101981019910200102011020210203102041020510206102071020810209102101021110212102131021410215102161021710218102191022010221102221022310224102251022610227102281022910230102311023210233102341023510236102371023810239102401024110242102431024410245102461024710248102491025010251102521025310254102551025610257102581025910260102611026210263102641026510266102671026810269102701027110272102731027410275102761027710278102791028010281102821028310284102851028610287102881028910290102911029210293102941029510296102971029810299103001030110302103031030410305103061030710308103091031010311103121031310314103151031610317103181031910320103211032210323103241032510326103271032810329103301033110332103331033410335103361033710338103391034010341103421034310344103451034610347103481034910350103511035210353103541035510356103571035810359103601036110362103631036410365103661036710368103691037010371103721037310374103751037610377103781037910380103811038210383103841038510386103871038810389103901039110392103931039410395103961039710398103991040010401104021040310404104051040610407104081040910410104111041210413104141041510416104171041810419104201042110422104231042410425104261042710428104291043010431104321043310434104351043610437104381043910440104411044210443104441044510446104471044810449104501045110452104531045410455104561045710458104591046010461104621046310464104651046610467104681046910470104711047210473104741047510476104771047810479104801048110482104831048410485104861048710488104891049010491104921049310494104951049610497104981049910500105011050210503105041050510506105071050810509105101051110512105131051410515105161051710518105191052010521105221052310524105251052610527105281052910530105311053210533105341053510536105371053810539105401054110542105431054410545105461054710548105491055010551105521055310554105551055610557105581055910560105611056210563105641056510566105671056810569105701057110572105731057410575105761057710578105791058010581105821058310584105851058610587105881058910590105911059210593105941059510596105971059810599106001060110602106031060410605106061060710608106091061010611106121061310614106151061610617106181061910620106211062210623106241062510626106271062810629106301063110632106331063410635106361063710638106391064010641106421064310644106451064610647106481064910650106511065210653106541065510656106571065810659106601066110662106631066410665106661066710668106691067010671106721067310674106751067610677106781067910680106811068210683106841068510686106871068810689106901069110692106931069410695106961069710698106991070010701107021070310704107051070610707107081070910710107111071210713107141071510716107171071810719107201072110722107231072410725107261072710728107291073010731107321073310734107351073610737107381073910740107411074210743107441074510746107471074810749107501075110752107531075410755107561075710758107591076010761107621076310764107651076610767107681076910770107711077210773107741077510776107771077810779107801078110782107831078410785107861078710788107891079010791107921079310794107951079610797107981079910800108011080210803108041080510806108071080810809108101081110812108131081410815108161081710818108191082010821108221082310824108251082610827108281082910830108311083210833108341083510836108371083810839108401084110842108431084410845108461084710848108491085010851108521085310854108551085610857108581085910860108611086210863108641086510866108671086810869108701087110872108731087410875108761087710878108791088010881108821088310884108851088610887108881088910890108911089210893108941089510896108971089810899109001090110902109031090410905109061090710908109091091010911109121091310914109151091610917109181091910920109211092210923109241092510926109271092810929109301093110932109331093410935109361093710938109391094010941109421094310944109451094610947109481094910950109511095210953109541095510956109571095810959109601096110962109631096410965109661096710968109691097010971109721097310974109751097610977109781097910980109811098210983109841098510986109871098810989109901099110992109931099410995109961099710998109991100011001110021100311004110051100611007110081100911010110111101211013110141101511016110171101811019110201102111022110231102411025110261102711028110291103011031110321103311034110351103611037110381103911040110411104211043110441104511046110471104811049110501105111052110531105411055110561105711058110591106011061110621106311064110651106611067110681106911070110711107211073110741107511076110771107811079110801108111082110831108411085110861108711088110891109011091110921109311094110951109611097110981109911100111011110211103111041110511106111071110811109111101111111112111131111411115111161111711118111191112011121111221112311124111251112611127111281112911130111311113211133111341113511136111371113811139111401114111142111431114411145111461114711148111491115011151111521115311154111551115611157111581115911160111611116211163111641116511166111671116811169111701117111172111731117411175111761117711178111791118011181111821118311184111851118611187111881118911190111911119211193111941119511196111971119811199112001120111202112031120411205112061120711208112091121011211112121121311214112151121611217112181121911220112211122211223112241122511226112271122811229112301123111232112331123411235112361123711238112391124011241112421124311244112451124611247112481124911250112511125211253112541125511256112571125811259112601126111262112631126411265112661126711268112691127011271112721127311274112751127611277112781127911280112811128211283112841128511286112871128811289112901129111292112931129411295112961129711298112991130011301113021130311304113051130611307113081130911310113111131211313113141131511316113171131811319113201132111322113231132411325113261132711328113291133011331113321133311334113351133611337113381133911340113411134211343113441134511346113471134811349113501135111352113531135411355113561135711358113591136011361113621136311364113651136611367113681136911370113711137211373113741137511376113771137811379113801138111382113831138411385113861138711388113891139011391113921139311394113951139611397113981139911400114011140211403114041140511406114071140811409114101141111412114131141411415114161141711418114191142011421114221142311424114251142611427114281142911430114311143211433114341143511436114371143811439114401144111442114431144411445114461144711448114491145011451114521145311454114551145611457114581145911460114611146211463114641146511466114671146811469114701147111472114731147411475114761147711478114791148011481114821148311484114851148611487114881148911490114911149211493114941149511496114971149811499115001150111502115031150411505115061150711508115091151011511115121151311514115151151611517115181151911520115211152211523115241152511526115271152811529115301153111532115331153411535115361153711538115391154011541115421154311544115451154611547115481154911550115511155211553115541155511556115571155811559115601156111562115631156411565115661156711568115691157011571115721157311574115751157611577115781157911580115811158211583115841158511586115871158811589115901159111592115931159411595115961159711598115991160011601116021160311604116051160611607116081160911610116111161211613116141161511616116171161811619116201162111622116231162411625116261162711628116291163011631116321163311634116351163611637116381163911640116411164211643116441164511646116471164811649116501165111652116531165411655116561165711658116591166011661116621166311664116651166611667116681166911670116711167211673116741167511676116771167811679116801168111682116831168411685116861168711688116891169011691116921169311694116951169611697116981169911700117011170211703117041170511706117071170811709117101171111712117131171411715117161171711718117191172011721117221172311724117251172611727117281172911730117311173211733117341173511736117371173811739117401174111742117431174411745117461174711748117491175011751117521175311754117551175611757117581175911760117611176211763117641176511766117671176811769117701177111772117731177411775117761177711778117791178011781117821178311784117851178611787117881178911790117911179211793117941179511796117971179811799118001180111802118031180411805118061180711808118091181011811118121181311814118151181611817118181181911820118211182211823118241182511826118271182811829118301183111832118331183411835118361183711838118391184011841118421184311844118451184611847118481184911850118511185211853118541185511856118571185811859118601186111862118631186411865118661186711868118691187011871118721187311874118751187611877118781187911880118811188211883118841188511886118871188811889118901189111892118931189411895118961189711898118991190011901119021190311904119051190611907119081190911910119111191211913119141191511916119171191811919119201192111922119231192411925119261192711928119291193011931119321193311934119351193611937119381193911940119411194211943119441194511946119471194811949119501195111952119531195411955119561195711958119591196011961119621196311964119651196611967119681196911970119711197211973119741197511976119771197811979119801198111982119831198411985119861198711988119891199011991119921199311994119951199611997119981199912000120011200212003120041200512006120071200812009120101201112012120131201412015120161201712018120191202012021120221202312024120251202612027120281202912030120311203212033120341203512036120371203812039120401204112042120431204412045120461204712048120491205012051120521205312054120551205612057120581205912060120611206212063120641206512066120671206812069120701207112072120731207412075120761207712078120791208012081120821208312084120851208612087120881208912090120911209212093120941209512096120971209812099121001210112102121031210412105121061210712108121091211012111121121211312114121151211612117121181211912120121211212212123121241212512126121271212812129121301213112132121331213412135121361213712138121391214012141121421214312144121451214612147121481214912150121511215212153121541215512156121571215812159121601216112162121631216412165121661216712168121691217012171121721217312174121751217612177121781217912180121811218212183121841218512186121871218812189121901219112192121931219412195121961219712198121991220012201122021220312204122051220612207122081220912210122111221212213122141221512216122171221812219122201222112222122231222412225122261222712228122291223012231122321223312234122351223612237122381223912240122411224212243122441224512246122471224812249122501225112252122531225412255122561225712258122591226012261122621226312264122651226612267122681226912270122711227212273122741227512276122771227812279122801228112282122831228412285122861228712288122891229012291122921229312294122951229612297122981229912300123011230212303123041230512306123071230812309123101231112312123131231412315123161231712318123191232012321123221232312324123251232612327123281232912330123311233212333123341233512336123371233812339123401234112342123431234412345123461234712348123491235012351123521235312354123551235612357123581235912360123611236212363123641236512366123671236812369123701237112372123731237412375123761237712378123791238012381123821238312384123851238612387123881238912390123911239212393123941239512396123971239812399124001240112402124031240412405124061240712408124091241012411124121241312414124151241612417124181241912420124211242212423124241242512426124271242812429124301243112432124331243412435124361243712438124391244012441124421244312444124451244612447124481244912450124511245212453124541245512456124571245812459124601246112462124631246412465124661246712468124691247012471124721247312474124751247612477124781247912480124811248212483124841248512486124871248812489124901249112492124931249412495124961249712498124991250012501125021250312504125051250612507125081250912510125111251212513125141251512516125171251812519125201252112522125231252412525125261252712528125291253012531125321253312534125351253612537125381253912540125411254212543125441254512546125471254812549125501255112552125531255412555125561255712558125591256012561125621256312564125651256612567125681256912570125711257212573125741257512576125771257812579125801258112582125831258412585125861258712588125891259012591125921259312594125951259612597125981259912600126011260212603126041260512606126071260812609126101261112612126131261412615126161261712618126191262012621126221262312624126251262612627126281262912630126311263212633126341263512636126371263812639126401264112642126431264412645126461264712648126491265012651126521265312654126551265612657126581265912660126611266212663126641266512666126671266812669126701267112672126731267412675126761267712678126791268012681126821268312684126851268612687126881268912690126911269212693126941269512696126971269812699127001270112702127031270412705127061270712708127091271012711127121271312714127151271612717127181271912720127211272212723127241272512726127271272812729127301273112732127331273412735127361273712738127391274012741127421274312744127451274612747127481274912750127511275212753127541275512756127571275812759127601276112762127631276412765127661276712768127691277012771127721277312774127751277612777127781277912780127811278212783127841278512786127871278812789127901279112792127931279412795127961279712798127991280012801128021280312804128051280612807128081280912810128111281212813128141281512816128171281812819128201282112822128231282412825128261282712828128291283012831128321283312834128351283612837128381283912840128411284212843128441284512846128471284812849128501285112852128531285412855128561285712858128591286012861128621286312864128651286612867128681286912870128711287212873128741287512876128771287812879128801288112882128831288412885128861288712888128891289012891128921289312894128951289612897128981289912900129011290212903129041290512906129071290812909129101291112912129131291412915129161291712918129191292012921129221292312924129251292612927129281292912930129311293212933129341293512936129371293812939129401294112942129431294412945129461294712948129491295012951129521295312954129551295612957129581295912960129611296212963129641296512966129671296812969129701297112972129731297412975129761297712978129791298012981129821298312984129851298612987129881298912990129911299212993129941299512996129971299812999130001300113002130031300413005130061300713008130091301013011130121301313014130151301613017130181301913020130211302213023130241302513026130271302813029130301303113032130331303413035130361303713038130391304013041130421304313044130451304613047130481304913050130511305213053130541305513056130571305813059130601306113062130631306413065130661306713068130691307013071130721307313074130751307613077130781307913080130811308213083130841308513086130871308813089130901309113092130931309413095130961309713098130991310013101131021310313104131051310613107131081310913110131111311213113131141311513116131171311813119131201312113122131231312413125131261312713128131291313013131131321313313134131351313613137131381313913140131411314213143131441314513146131471314813149131501315113152131531315413155131561315713158131591316013161131621316313164131651316613167131681316913170131711317213173131741317513176131771317813179131801318113182131831318413185131861318713188131891319013191131921319313194131951319613197131981319913200132011320213203132041320513206132071320813209132101321113212132131321413215132161321713218132191322013221132221322313224132251322613227132281322913230132311323213233132341323513236132371323813239132401324113242132431324413245132461324713248132491325013251132521325313254132551325613257132581325913260132611326213263132641326513266132671326813269132701327113272132731327413275132761327713278132791328013281132821328313284132851328613287132881328913290132911329213293132941329513296132971329813299133001330113302133031330413305133061330713308133091331013311133121331313314133151331613317133181331913320133211332213323133241332513326133271332813329133301333113332133331333413335133361333713338133391334013341133421334313344133451334613347133481334913350133511335213353133541335513356133571335813359133601336113362133631336413365133661336713368133691337013371133721337313374133751337613377133781337913380133811338213383133841338513386133871338813389133901339113392133931339413395133961339713398133991340013401134021340313404134051340613407134081340913410134111341213413134141341513416134171341813419134201342113422134231342413425134261342713428134291343013431134321343313434134351343613437134381343913440134411344213443134441344513446134471344813449134501345113452134531345413455134561345713458134591346013461134621346313464134651346613467134681346913470134711347213473134741347513476134771347813479134801348113482134831348413485134861348713488134891349013491134921349313494134951349613497134981349913500135011350213503135041350513506135071350813509135101351113512135131351413515135161351713518135191352013521135221352313524135251352613527135281352913530135311353213533135341353513536135371353813539135401354113542135431354413545135461354713548135491355013551135521355313554135551355613557135581355913560135611356213563135641356513566135671356813569135701357113572135731357413575135761357713578135791358013581135821358313584135851358613587135881358913590135911359213593135941359513596135971359813599136001360113602136031360413605136061360713608136091361013611136121361313614136151361613617136181361913620136211362213623136241362513626136271362813629136301363113632136331363413635136361363713638136391364013641136421364313644136451364613647136481364913650136511365213653136541365513656136571365813659136601366113662136631366413665136661366713668136691367013671136721367313674136751367613677136781367913680136811368213683136841368513686136871368813689136901369113692136931369413695136961369713698136991370013701137021370313704137051370613707137081370913710137111371213713137141371513716137171371813719137201372113722137231372413725137261372713728137291373013731137321373313734137351373613737137381373913740137411374213743137441374513746137471374813749137501375113752137531375413755137561375713758137591376013761137621376313764137651376613767137681376913770137711377213773137741377513776137771377813779137801378113782137831378413785137861378713788137891379013791137921379313794137951379613797137981379913800138011380213803138041380513806138071380813809138101381113812138131381413815138161381713818138191382013821138221382313824138251382613827138281382913830138311383213833138341383513836138371383813839138401384113842138431384413845138461384713848138491385013851138521385313854138551385613857138581385913860138611386213863138641386513866138671386813869138701387113872138731387413875138761387713878138791388013881138821388313884138851388613887138881388913890138911389213893138941389513896138971389813899139001390113902139031390413905139061390713908139091391013911139121391313914139151391613917139181391913920139211392213923139241392513926139271392813929139301393113932139331393413935139361393713938139391394013941139421394313944139451394613947139481394913950139511395213953139541395513956139571395813959139601396113962139631396413965139661396713968139691397013971139721397313974139751397613977139781397913980139811398213983139841398513986139871398813989139901399113992139931399413995139961399713998139991400014001140021400314004140051400614007140081400914010140111401214013140141401514016140171401814019140201402114022140231402414025140261402714028140291403014031140321403314034140351403614037140381403914040140411404214043140441404514046140471404814049140501405114052140531405414055140561405714058140591406014061140621406314064140651406614067140681406914070140711407214073140741407514076140771407814079140801408114082140831408414085140861408714088140891409014091140921409314094140951409614097140981409914100141011410214103141041410514106141071410814109141101411114112141131411414115141161411714118141191412014121141221412314124141251412614127141281412914130141311413214133141341413514136141371413814139141401414114142141431414414145141461414714148141491415014151141521415314154141551415614157141581415914160141611416214163141641416514166141671416814169141701417114172141731417414175141761417714178141791418014181141821418314184141851418614187141881418914190141911419214193141941419514196141971419814199142001420114202142031420414205142061420714208142091421014211142121421314214142151421614217142181421914220142211422214223142241422514226142271422814229142301423114232142331423414235142361423714238142391424014241142421424314244142451424614247142481424914250142511425214253142541425514256142571425814259142601426114262142631426414265142661426714268142691427014271142721427314274142751427614277142781427914280142811428214283142841428514286142871428814289142901429114292142931429414295142961429714298142991430014301143021430314304143051430614307143081430914310143111431214313143141431514316143171431814319143201432114322143231432414325143261432714328143291433014331143321433314334143351433614337143381433914340143411434214343143441434514346143471434814349143501435114352143531435414355143561435714358143591436014361143621436314364143651436614367143681436914370143711437214373143741437514376143771437814379143801438114382143831438414385143861438714388143891439014391143921439314394143951439614397143981439914400144011440214403144041440514406144071440814409144101441114412144131441414415144161441714418144191442014421144221442314424144251442614427144281442914430144311443214433144341443514436144371443814439144401444114442144431444414445144461444714448144491445014451144521445314454144551445614457144581445914460144611446214463144641446514466144671446814469144701447114472144731447414475144761447714478144791448014481144821448314484144851448614487144881448914490144911449214493144941449514496144971449814499145001450114502145031450414505145061450714508145091451014511145121451314514145151451614517145181451914520145211452214523145241452514526145271452814529145301453114532145331453414535145361453714538145391454014541145421454314544145451454614547145481454914550145511455214553145541455514556145571455814559145601456114562145631456414565145661456714568145691457014571145721457314574145751457614577145781457914580145811458214583145841458514586145871458814589145901459114592145931459414595145961459714598145991460014601146021460314604146051460614607146081460914610146111461214613146141461514616146171461814619146201462114622146231462414625146261462714628146291463014631146321463314634146351463614637146381463914640146411464214643146441464514646146471464814649146501465114652146531465414655146561465714658146591466014661146621466314664146651466614667146681466914670146711467214673146741467514676146771467814679146801468114682146831468414685146861468714688146891469014691146921469314694146951469614697146981469914700147011470214703147041470514706147071470814709147101471114712147131471414715147161471714718147191472014721147221472314724147251472614727147281472914730147311473214733147341473514736147371473814739147401474114742147431474414745147461474714748147491475014751147521475314754147551475614757147581475914760147611476214763147641476514766147671476814769147701477114772147731477414775147761477714778147791478014781147821478314784147851478614787147881478914790147911479214793147941479514796147971479814799148001480114802148031480414805148061480714808148091481014811148121481314814148151481614817148181481914820148211482214823148241482514826148271482814829148301483114832148331483414835148361483714838148391484014841148421484314844148451484614847148481484914850148511485214853148541485514856148571485814859148601486114862148631486414865148661486714868148691487014871148721487314874148751487614877148781487914880148811488214883148841488514886148871488814889148901489114892148931489414895148961489714898148991490014901149021490314904149051490614907149081490914910149111491214913149141491514916149171491814919149201492114922149231492414925149261492714928149291493014931149321493314934149351493614937149381493914940149411494214943149441494514946149471494814949149501495114952149531495414955149561495714958149591496014961149621496314964149651496614967149681496914970149711497214973149741497514976149771497814979149801498114982149831498414985149861498714988149891499014991149921499314994149951499614997149981499915000150011500215003150041500515006150071500815009150101501115012150131501415015150161501715018150191502015021150221502315024150251502615027150281502915030150311503215033150341503515036150371503815039150401504115042150431504415045150461504715048150491505015051150521505315054150551505615057150581505915060150611506215063150641506515066150671506815069150701507115072150731507415075150761507715078150791508015081150821508315084150851508615087150881508915090150911509215093150941509515096150971509815099151001510115102151031510415105151061510715108151091511015111151121511315114151151511615117151181511915120151211512215123151241512515126151271512815129151301513115132151331513415135151361513715138151391514015141151421514315144151451514615147151481514915150151511515215153151541515515156151571515815159151601516115162151631516415165151661516715168151691517015171151721517315174151751517615177151781517915180151811518215183151841518515186151871518815189151901519115192151931519415195151961519715198151991520015201152021520315204152051520615207152081520915210152111521215213152141521515216152171521815219152201522115222152231522415225152261522715228152291523015231152321523315234152351523615237152381523915240152411524215243152441524515246152471524815249152501525115252152531525415255152561525715258152591526015261152621526315264152651526615267152681526915270152711527215273152741527515276152771527815279152801528115282152831528415285152861528715288152891529015291152921529315294152951529615297152981529915300153011530215303153041530515306153071530815309153101531115312153131531415315153161531715318153191532015321153221532315324153251532615327153281532915330153311533215333153341533515336153371533815339153401534115342153431534415345153461534715348153491535015351153521535315354153551535615357153581535915360153611536215363153641536515366153671536815369153701537115372153731537415375153761537715378153791538015381153821538315384153851538615387153881538915390153911539215393153941539515396153971539815399154001540115402154031540415405154061540715408154091541015411154121541315414154151541615417154181541915420154211542215423154241542515426154271542815429154301543115432154331543415435154361543715438154391544015441154421544315444154451544615447154481544915450154511545215453154541545515456154571545815459154601546115462154631546415465154661546715468154691547015471154721547315474154751547615477154781547915480154811548215483154841548515486154871548815489154901549115492154931549415495154961549715498154991550015501155021550315504155051550615507155081550915510155111551215513155141551515516155171551815519155201552115522155231552415525155261552715528155291553015531155321553315534155351553615537155381553915540155411554215543155441554515546155471554815549155501555115552155531555415555155561555715558155591556015561155621556315564155651556615567155681556915570155711557215573155741557515576155771557815579155801558115582155831558415585155861558715588155891559015591155921559315594155951559615597155981559915600156011560215603156041560515606156071560815609156101561115612156131561415615156161561715618156191562015621156221562315624156251562615627156281562915630156311563215633156341563515636156371563815639156401564115642156431564415645156461564715648156491565015651156521565315654156551565615657156581565915660156611566215663156641566515666156671566815669156701567115672156731567415675156761567715678156791568015681156821568315684156851568615687156881568915690156911569215693156941569515696156971569815699157001570115702157031570415705157061570715708157091571015711157121571315714157151571615717157181571915720157211572215723157241572515726157271572815729157301573115732157331573415735157361573715738157391574015741157421574315744157451574615747157481574915750157511575215753157541575515756157571575815759157601576115762157631576415765157661576715768157691577015771157721577315774157751577615777157781577915780157811578215783157841578515786157871578815789157901579115792157931579415795157961579715798157991580015801158021580315804158051580615807158081580915810158111581215813158141581515816158171581815819158201582115822158231582415825158261582715828158291583015831158321583315834158351583615837158381583915840158411584215843158441584515846158471584815849158501585115852158531585415855158561585715858158591586015861158621586315864158651586615867158681586915870158711587215873158741587515876158771587815879158801588115882158831588415885158861588715888158891589015891158921589315894158951589615897158981589915900159011590215903159041590515906159071590815909159101591115912159131591415915159161591715918159191592015921159221592315924159251592615927159281592915930159311593215933159341593515936159371593815939159401594115942159431594415945159461594715948159491595015951159521595315954159551595615957159581595915960159611596215963159641596515966159671596815969159701597115972159731597415975159761597715978159791598015981159821598315984159851598615987159881598915990159911599215993159941599515996159971599815999160001600116002160031600416005160061600716008160091601016011160121601316014160151601616017160181601916020160211602216023160241602516026160271602816029160301603116032160331603416035160361603716038160391604016041160421604316044160451604616047160481604916050160511605216053160541605516056160571605816059160601606116062160631606416065160661606716068160691607016071160721607316074160751607616077160781607916080160811608216083160841608516086160871608816089160901609116092160931609416095160961609716098160991610016101161021610316104161051610616107161081610916110161111611216113161141611516116161171611816119161201612116122161231612416125161261612716128161291613016131161321613316134161351613616137161381613916140161411614216143161441614516146161471614816149161501615116152161531615416155161561615716158161591616016161161621616316164161651616616167161681616916170161711617216173161741617516176161771617816179161801618116182161831618416185161861618716188161891619016191161921619316194161951619616197161981619916200162011620216203162041620516206162071620816209162101621116212162131621416215162161621716218162191622016221162221622316224162251622616227162281622916230162311623216233162341623516236162371623816239162401624116242162431624416245162461624716248162491625016251162521625316254162551625616257162581625916260162611626216263162641626516266162671626816269162701627116272162731627416275162761627716278162791628016281162821628316284162851628616287162881628916290162911629216293162941629516296162971629816299163001630116302163031630416305163061630716308163091631016311163121631316314163151631616317163181631916320163211632216323163241632516326163271632816329163301633116332163331633416335163361633716338163391634016341163421634316344163451634616347163481634916350163511635216353163541635516356163571635816359163601636116362163631636416365163661636716368163691637016371163721637316374163751637616377163781637916380163811638216383163841638516386163871638816389163901639116392163931639416395163961639716398163991640016401164021640316404164051640616407164081640916410164111641216413164141641516416164171641816419164201642116422164231642416425164261642716428164291643016431164321643316434164351643616437164381643916440164411644216443164441644516446164471644816449164501645116452164531645416455164561645716458164591646016461164621646316464164651646616467164681646916470164711647216473164741647516476164771647816479164801648116482164831648416485164861648716488164891649016491164921649316494164951649616497164981649916500165011650216503165041650516506165071650816509165101651116512165131651416515165161651716518165191652016521165221652316524165251652616527165281652916530165311653216533165341653516536165371653816539165401654116542165431654416545165461654716548165491655016551165521655316554165551655616557165581655916560165611656216563165641656516566165671656816569165701657116572165731657416575165761657716578165791658016581165821658316584165851658616587165881658916590165911659216593165941659516596165971659816599166001660116602166031660416605166061660716608166091661016611166121661316614166151661616617166181661916620166211662216623166241662516626166271662816629166301663116632166331663416635166361663716638166391664016641166421664316644166451664616647166481664916650166511665216653166541665516656166571665816659166601666116662166631666416665166661666716668166691667016671166721667316674166751667616677166781667916680166811668216683166841668516686166871668816689166901669116692166931669416695166961669716698166991670016701167021670316704167051670616707167081670916710167111671216713167141671516716167171671816719167201672116722167231672416725167261672716728167291673016731167321673316734167351673616737167381673916740167411674216743167441674516746167471674816749167501675116752167531675416755167561675716758167591676016761167621676316764167651676616767167681676916770167711677216773167741677516776167771677816779167801678116782167831678416785167861678716788167891679016791167921679316794167951679616797167981679916800168011680216803168041680516806168071680816809168101681116812168131681416815168161681716818168191682016821168221682316824168251682616827168281682916830168311683216833168341683516836168371683816839168401684116842168431684416845168461684716848168491685016851168521685316854168551685616857168581685916860168611686216863168641686516866168671686816869168701687116872168731687416875168761687716878168791688016881168821688316884168851688616887168881688916890168911689216893168941689516896168971689816899169001690116902169031690416905169061690716908169091691016911169121691316914169151691616917169181691916920169211692216923169241692516926169271692816929169301693116932169331693416935169361693716938169391694016941169421694316944169451694616947169481694916950169511695216953169541695516956169571695816959169601696116962169631696416965169661696716968169691697016971169721697316974169751697616977169781697916980169811698216983169841698516986169871698816989169901699116992169931699416995169961699716998169991700017001170021700317004170051700617007170081700917010170111701217013170141701517016170171701817019170201702117022170231702417025170261702717028170291703017031170321703317034170351703617037170381703917040170411704217043170441704517046170471704817049170501705117052170531705417055170561705717058170591706017061170621706317064170651706617067170681706917070170711707217073170741707517076170771707817079170801708117082170831708417085170861708717088170891709017091170921709317094170951709617097170981709917100171011710217103171041710517106171071710817109171101711117112171131711417115171161711717118171191712017121171221712317124171251712617127171281712917130171311713217133171341713517136171371713817139171401714117142171431714417145171461714717148171491715017151171521715317154171551715617157171581715917160171611716217163171641716517166171671716817169171701717117172171731717417175171761717717178171791718017181171821718317184171851718617187171881718917190171911719217193171941719517196171971719817199172001720117202172031720417205172061720717208172091721017211172121721317214172151721617217172181721917220172211722217223172241722517226172271722817229172301723117232172331723417235172361723717238172391724017241172421724317244172451724617247172481724917250172511725217253172541725517256172571725817259172601726117262172631726417265172661726717268172691727017271172721727317274172751727617277172781727917280172811728217283172841728517286172871728817289172901729117292172931729417295172961729717298172991730017301173021730317304173051730617307173081730917310173111731217313173141731517316173171731817319173201732117322173231732417325173261732717328173291733017331173321733317334173351733617337173381733917340173411734217343173441734517346173471734817349173501735117352173531735417355173561735717358173591736017361173621736317364173651736617367173681736917370173711737217373173741737517376173771737817379173801738117382173831738417385173861738717388173891739017391173921739317394173951739617397173981739917400174011740217403174041740517406174071740817409174101741117412174131741417415174161741717418174191742017421174221742317424174251742617427174281742917430174311743217433174341743517436174371743817439174401744117442174431744417445174461744717448174491745017451174521745317454174551745617457174581745917460174611746217463174641746517466174671746817469174701747117472174731747417475174761747717478174791748017481174821748317484174851748617487174881748917490174911749217493174941749517496174971749817499175001750117502175031750417505175061750717508175091751017511175121751317514175151751617517175181751917520175211752217523175241752517526175271752817529175301753117532175331753417535175361753717538175391754017541175421754317544175451754617547175481754917550175511755217553175541755517556175571755817559175601756117562175631756417565175661756717568175691757017571175721757317574175751757617577175781757917580175811758217583175841758517586175871758817589175901759117592175931759417595175961759717598175991760017601176021760317604176051760617607176081760917610176111761217613176141761517616176171761817619176201762117622176231762417625176261762717628176291763017631176321763317634176351763617637176381763917640176411764217643176441764517646176471764817649176501765117652176531765417655176561765717658176591766017661176621766317664176651766617667176681766917670176711767217673176741767517676176771767817679176801768117682176831768417685176861768717688176891769017691176921769317694176951769617697176981769917700177011770217703177041770517706177071770817709177101771117712177131771417715177161771717718177191772017721177221772317724177251772617727177281772917730177311773217733177341773517736177371773817739177401774117742177431774417745177461774717748177491775017751177521775317754177551775617757177581775917760177611776217763177641776517766177671776817769177701777117772177731777417775177761777717778177791778017781177821778317784177851778617787177881778917790177911779217793177941779517796177971779817799178001780117802178031780417805178061780717808178091781017811178121781317814178151781617817178181781917820178211782217823178241782517826178271782817829178301783117832178331783417835178361783717838178391784017841178421784317844178451784617847178481784917850178511785217853178541785517856178571785817859178601786117862178631786417865178661786717868178691787017871178721787317874178751787617877178781787917880178811788217883178841788517886178871788817889178901789117892178931789417895178961789717898178991790017901179021790317904179051790617907179081790917910179111791217913179141791517916179171791817919179201792117922179231792417925179261792717928179291793017931179321793317934179351793617937179381793917940179411794217943179441794517946179471794817949179501795117952179531795417955179561795717958179591796017961179621796317964179651796617967179681796917970179711797217973179741797517976179771797817979179801798117982179831798417985179861798717988179891799017991179921799317994179951799617997179981799918000180011800218003180041800518006180071800818009180101801118012180131801418015180161801718018180191802018021180221802318024180251802618027180281802918030180311803218033180341803518036180371803818039180401804118042180431804418045180461804718048180491805018051180521805318054180551805618057180581805918060180611806218063180641806518066180671806818069180701807118072180731807418075180761807718078180791808018081180821808318084180851808618087180881808918090180911809218093180941809518096180971809818099181001810118102181031810418105181061810718108181091811018111181121811318114181151811618117181181811918120181211812218123181241812518126181271812818129181301813118132181331813418135181361813718138181391814018141181421814318144181451814618147181481814918150181511815218153181541815518156181571815818159181601816118162181631816418165181661816718168181691817018171181721817318174181751817618177181781817918180181811818218183181841818518186181871818818189181901819118192181931819418195181961819718198181991820018201182021820318204182051820618207182081820918210182111821218213182141821518216182171821818219182201822118222182231822418225182261822718228182291823018231182321823318234182351823618237182381823918240182411824218243182441824518246182471824818249182501825118252182531825418255182561825718258182591826018261182621826318264182651826618267182681826918270182711827218273182741827518276182771827818279182801828118282182831828418285182861828718288182891829018291182921829318294182951829618297182981829918300183011830218303183041830518306183071830818309183101831118312183131831418315183161831718318183191832018321183221832318324183251832618327183281832918330183311833218333183341833518336183371833818339183401834118342183431834418345183461834718348183491835018351183521835318354183551835618357183581835918360183611836218363183641836518366183671836818369183701837118372183731837418375183761837718378183791838018381183821838318384183851838618387183881838918390183911839218393183941839518396183971839818399184001840118402184031840418405184061840718408184091841018411184121841318414184151841618417184181841918420184211842218423184241842518426184271842818429184301843118432184331843418435184361843718438184391844018441184421844318444184451844618447184481844918450184511845218453184541845518456184571845818459184601846118462184631846418465184661846718468184691847018471184721847318474184751847618477184781847918480184811848218483184841848518486184871848818489184901849118492184931849418495184961849718498184991850018501185021850318504185051850618507185081850918510185111851218513185141851518516185171851818519185201852118522185231852418525185261852718528185291853018531185321853318534185351853618537185381853918540185411854218543185441854518546185471854818549185501855118552185531855418555185561855718558185591856018561185621856318564185651856618567185681856918570185711857218573185741857518576185771857818579185801858118582185831858418585185861858718588185891859018591185921859318594185951859618597185981859918600186011860218603186041860518606186071860818609186101861118612186131861418615186161861718618186191862018621186221862318624186251862618627186281862918630186311863218633186341863518636186371863818639186401864118642186431864418645186461864718648186491865018651186521865318654186551865618657186581865918660186611866218663186641866518666186671866818669186701867118672186731867418675186761867718678186791868018681186821868318684186851868618687186881868918690186911869218693186941869518696186971869818699187001870118702187031870418705187061870718708187091871018711187121871318714187151871618717187181871918720187211872218723187241872518726187271872818729187301873118732187331873418735187361873718738187391874018741187421874318744187451874618747187481874918750187511875218753187541875518756187571875818759187601876118762187631876418765187661876718768187691877018771187721877318774187751877618777187781877918780187811878218783187841878518786187871878818789187901879118792187931879418795187961879718798187991880018801188021880318804188051880618807188081880918810188111881218813188141881518816188171881818819188201882118822188231882418825188261882718828188291883018831188321883318834188351883618837188381883918840188411884218843188441884518846188471884818849188501885118852188531885418855188561885718858188591886018861188621886318864188651886618867188681886918870188711887218873188741887518876188771887818879188801888118882188831888418885188861888718888188891889018891188921889318894188951889618897188981889918900189011890218903189041890518906189071890818909189101891118912189131891418915189161891718918189191892018921189221892318924189251892618927189281892918930189311893218933189341893518936189371893818939189401894118942189431894418945189461894718948189491895018951189521895318954189551895618957189581895918960189611896218963189641896518966189671896818969189701897118972189731897418975189761897718978189791898018981189821898318984189851898618987189881898918990189911899218993189941899518996189971899818999190001900119002190031900419005190061900719008190091901019011190121901319014190151901619017190181901919020190211902219023190241902519026190271902819029190301903119032190331903419035190361903719038190391904019041190421904319044190451904619047190481904919050190511905219053190541905519056190571905819059190601906119062190631906419065190661906719068190691907019071190721907319074190751907619077190781907919080190811908219083190841908519086190871908819089190901909119092190931909419095190961909719098190991910019101191021910319104191051910619107191081910919110191111911219113191141911519116191171911819119191201912119122191231912419125191261912719128191291913019131191321913319134191351913619137191381913919140191411914219143191441914519146191471914819149191501915119152191531915419155191561915719158191591916019161191621916319164191651916619167191681916919170191711917219173191741917519176191771917819179191801918119182191831918419185191861918719188191891919019191191921919319194191951919619197191981919919200192011920219203192041920519206192071920819209192101921119212192131921419215192161921719218192191922019221192221922319224192251922619227192281922919230192311923219233192341923519236192371923819239192401924119242192431924419245192461924719248192491925019251192521925319254192551925619257192581925919260192611926219263192641926519266192671926819269192701927119272192731927419275192761927719278192791928019281192821928319284192851928619287192881928919290192911929219293192941929519296192971929819299193001930119302193031930419305193061930719308193091931019311193121931319314193151931619317193181931919320193211932219323193241932519326193271932819329193301933119332193331933419335193361933719338193391934019341193421934319344193451934619347193481934919350193511935219353193541935519356193571935819359193601936119362193631936419365193661936719368193691937019371193721937319374193751937619377193781937919380193811938219383193841938519386193871938819389193901939119392193931939419395193961939719398193991940019401194021940319404194051940619407194081940919410194111941219413194141941519416194171941819419194201942119422194231942419425194261942719428194291943019431194321943319434194351943619437194381943919440194411944219443194441944519446194471944819449194501945119452194531945419455194561945719458194591946019461194621946319464194651946619467194681946919470194711947219473194741947519476194771947819479194801948119482194831948419485194861948719488194891949019491194921949319494194951949619497194981949919500195011950219503195041950519506195071950819509195101951119512195131951419515195161951719518195191952019521195221952319524195251952619527195281952919530195311953219533195341953519536195371953819539195401954119542195431954419545195461954719548195491955019551195521955319554195551955619557195581955919560195611956219563195641956519566195671956819569195701957119572195731957419575195761957719578195791958019581195821958319584195851958619587195881958919590195911959219593195941959519596195971959819599196001960119602196031960419605196061960719608196091961019611196121961319614196151961619617196181961919620196211962219623196241962519626196271962819629196301963119632196331963419635196361963719638196391964019641196421964319644196451964619647196481964919650196511965219653196541965519656196571965819659196601966119662196631966419665196661966719668196691967019671196721967319674196751967619677196781967919680196811968219683196841968519686196871968819689196901969119692196931969419695196961969719698196991970019701197021970319704197051970619707197081970919710197111971219713197141971519716197171971819719197201972119722197231972419725197261972719728197291973019731197321973319734197351973619737197381973919740197411974219743197441974519746197471974819749197501975119752197531975419755197561975719758197591976019761197621976319764197651976619767197681976919770197711977219773197741977519776197771977819779197801978119782197831978419785197861978719788197891979019791197921979319794197951979619797197981979919800198011980219803198041980519806198071980819809198101981119812198131981419815198161981719818198191982019821198221982319824198251982619827198281982919830198311983219833198341983519836198371983819839198401984119842198431984419845198461984719848198491985019851198521985319854198551985619857198581985919860198611986219863198641986519866198671986819869198701987119872198731987419875198761987719878198791988019881198821988319884198851988619887198881988919890198911989219893198941989519896198971989819899199001990119902199031990419905199061990719908199091991019911199121991319914199151991619917199181991919920199211992219923199241992519926199271992819929199301993119932199331993419935199361993719938199391994019941199421994319944199451994619947199481994919950199511995219953199541995519956199571995819959199601996119962199631996419965199661996719968199691997019971199721997319974199751997619977199781997919980199811998219983199841998519986199871998819989199901999119992199931999419995199961999719998199992000020001200022000320004200052000620007200082000920010200112001220013200142001520016200172001820019200202002120022200232002420025200262002720028200292003020031200322003320034200352003620037200382003920040200412004220043200442004520046200472004820049200502005120052200532005420055200562005720058200592006020061200622006320064200652006620067200682006920070200712007220073200742007520076200772007820079200802008120082200832008420085200862008720088200892009020091200922009320094200952009620097200982009920100201012010220103201042010520106201072010820109201102011120112201132011420115201162011720118201192012020121201222012320124201252012620127201282012920130201312013220133201342013520136201372013820139201402014120142201432014420145201462014720148201492015020151201522015320154201552015620157201582015920160201612016220163201642016520166201672016820169201702017120172201732017420175201762017720178201792018020181201822018320184201852018620187201882018920190201912019220193201942019520196201972019820199202002020120202202032020420205202062020720208202092021020211202122021320214202152021620217202182021920220202212022220223202242022520226202272022820229202302023120232202332023420235202362023720238202392024020241202422024320244202452024620247202482024920250202512025220253202542025520256202572025820259202602026120262202632026420265202662026720268202692027020271202722027320274202752027620277202782027920280202812028220283202842028520286202872028820289202902029120292202932029420295202962029720298202992030020301203022030320304203052030620307203082030920310203112031220313203142031520316203172031820319203202032120322203232032420325203262032720328203292033020331203322033320334203352033620337203382033920340203412034220343203442034520346203472034820349203502035120352203532035420355203562035720358203592036020361203622036320364203652036620367203682036920370203712037220373203742037520376203772037820379203802038120382203832038420385203862038720388203892039020391203922039320394203952039620397203982039920400204012040220403204042040520406204072040820409204102041120412204132041420415204162041720418204192042020421204222042320424204252042620427204282042920430204312043220433204342043520436204372043820439204402044120442204432044420445204462044720448204492045020451204522045320454204552045620457204582045920460204612046220463204642046520466204672046820469204702047120472204732047420475204762047720478204792048020481204822048320484204852048620487204882048920490204912049220493204942049520496204972049820499205002050120502205032050420505205062050720508205092051020511205122051320514205152051620517205182051920520205212052220523205242052520526205272052820529205302053120532205332053420535205362053720538205392054020541205422054320544205452054620547205482054920550205512055220553205542055520556205572055820559205602056120562205632056420565205662056720568205692057020571205722057320574205752057620577205782057920580205812058220583205842058520586205872058820589205902059120592205932059420595205962059720598205992060020601206022060320604206052060620607206082060920610206112061220613206142061520616206172061820619206202062120622206232062420625206262062720628206292063020631206322063320634206352063620637206382063920640206412064220643206442064520646206472064820649206502065120652206532065420655206562065720658206592066020661206622066320664206652066620667206682066920670206712067220673206742067520676206772067820679206802068120682206832068420685206862068720688206892069020691206922069320694206952069620697206982069920700207012070220703207042070520706207072070820709207102071120712207132071420715207162071720718207192072020721207222072320724207252072620727207282072920730207312073220733207342073520736207372073820739207402074120742207432074420745207462074720748207492075020751207522075320754207552075620757207582075920760207612076220763207642076520766207672076820769207702077120772207732077420775207762077720778207792078020781207822078320784207852078620787207882078920790207912079220793207942079520796207972079820799208002080120802208032080420805208062080720808208092081020811208122081320814208152081620817208182081920820208212082220823208242082520826208272082820829208302083120832208332083420835208362083720838208392084020841208422084320844208452084620847208482084920850208512085220853208542085520856208572085820859208602086120862208632086420865208662086720868208692087020871208722087320874208752087620877208782087920880208812088220883208842088520886208872088820889208902089120892208932089420895208962089720898208992090020901209022090320904209052090620907209082090920910209112091220913209142091520916209172091820919209202092120922209232092420925209262092720928209292093020931209322093320934209352093620937209382093920940209412094220943209442094520946209472094820949209502095120952209532095420955209562095720958209592096020961209622096320964209652096620967209682096920970209712097220973209742097520976209772097820979209802098120982209832098420985209862098720988209892099020991209922099320994209952099620997209982099921000210012100221003210042100521006210072100821009210102101121012210132101421015210162101721018210192102021021210222102321024210252102621027210282102921030210312103221033210342103521036210372103821039210402104121042210432104421045210462104721048210492105021051210522105321054210552105621057210582105921060210612106221063210642106521066210672106821069210702107121072210732107421075210762107721078210792108021081210822108321084210852108621087210882108921090210912109221093210942109521096210972109821099211002110121102211032110421105211062110721108211092111021111211122111321114211152111621117211182111921120211212112221123211242112521126211272112821129211302113121132211332113421135211362113721138211392114021141211422114321144211452114621147211482114921150211512115221153211542115521156211572115821159211602116121162211632116421165211662116721168211692117021171211722117321174211752117621177211782117921180211812118221183211842118521186211872118821189211902119121192211932119421195211962119721198211992120021201212022120321204212052120621207212082120921210212112121221213212142121521216212172121821219212202122121222212232122421225212262122721228212292123021231212322123321234212352123621237212382123921240212412124221243212442124521246212472124821249212502125121252212532125421255212562125721258212592126021261212622126321264212652126621267212682126921270212712127221273212742127521276212772127821279212802128121282212832128421285212862128721288212892129021291212922129321294212952129621297212982129921300213012130221303213042130521306213072130821309213102131121312213132131421315213162131721318213192132021321213222132321324213252132621327213282132921330213312133221333213342133521336213372133821339213402134121342213432134421345213462134721348213492135021351213522135321354213552135621357213582135921360213612136221363213642136521366213672136821369213702137121372213732137421375213762137721378213792138021381213822138321384213852138621387213882138921390213912139221393213942139521396213972139821399214002140121402214032140421405214062140721408214092141021411214122141321414214152141621417214182141921420214212142221423214242142521426214272142821429214302143121432214332143421435214362143721438214392144021441214422144321444214452144621447214482144921450214512145221453214542145521456214572145821459214602146121462214632146421465214662146721468214692147021471214722147321474214752147621477214782147921480214812148221483214842148521486214872148821489214902149121492214932149421495214962149721498214992150021501215022150321504215052150621507215082150921510215112151221513215142151521516215172151821519215202152121522215232152421525215262152721528215292153021531215322153321534215352153621537215382153921540215412154221543215442154521546215472154821549215502155121552215532155421555215562155721558215592156021561215622156321564215652156621567215682156921570215712157221573215742157521576215772157821579215802158121582215832158421585215862158721588215892159021591215922159321594215952159621597215982159921600216012160221603216042160521606216072160821609216102161121612216132161421615216162161721618216192162021621216222162321624216252162621627216282162921630216312163221633216342163521636216372163821639216402164121642216432164421645216462164721648216492165021651216522165321654216552165621657216582165921660216612166221663216642166521666216672166821669216702167121672216732167421675216762167721678216792168021681216822168321684216852168621687216882168921690216912169221693216942169521696216972169821699217002170121702217032170421705217062170721708217092171021711217122171321714217152171621717217182171921720217212172221723217242172521726217272172821729217302173121732217332173421735217362173721738217392174021741217422174321744217452174621747217482174921750217512175221753217542175521756217572175821759217602176121762217632176421765217662176721768217692177021771217722177321774217752177621777217782177921780217812178221783217842178521786217872178821789217902179121792217932179421795217962179721798217992180021801218022180321804218052180621807218082180921810218112181221813218142181521816218172181821819218202182121822218232182421825218262182721828218292183021831218322183321834218352183621837218382183921840218412184221843218442184521846218472184821849218502185121852218532185421855218562185721858218592186021861218622186321864218652186621867218682186921870218712187221873218742187521876218772187821879218802188121882218832188421885218862188721888218892189021891218922189321894218952189621897218982189921900219012190221903219042190521906219072190821909219102191121912219132191421915219162191721918219192192021921219222192321924219252192621927219282192921930219312193221933219342193521936219372193821939219402194121942219432194421945219462194721948219492195021951219522195321954219552195621957219582195921960219612196221963219642196521966219672196821969219702197121972219732197421975219762197721978219792198021981219822198321984219852198621987219882198921990219912199221993219942199521996219972199821999220002200122002220032200422005220062200722008220092201022011220122201322014220152201622017220182201922020220212202222023220242202522026220272202822029220302203122032220332203422035220362203722038220392204022041220422204322044220452204622047220482204922050220512205222053220542205522056220572205822059220602206122062220632206422065220662206722068220692207022071220722207322074220752207622077220782207922080220812208222083220842208522086220872208822089220902209122092220932209422095220962209722098220992210022101221022210322104221052210622107221082210922110221112211222113221142211522116221172211822119221202212122122221232212422125221262212722128221292213022131221322213322134221352213622137221382213922140221412214222143221442214522146221472214822149221502215122152221532215422155221562215722158221592216022161221622216322164221652216622167221682216922170221712217222173221742217522176221772217822179221802218122182221832218422185221862218722188221892219022191221922219322194221952219622197221982219922200222012220222203222042220522206222072220822209222102221122212222132221422215222162221722218222192222022221222222222322224222252222622227222282222922230222312223222233222342223522236222372223822239222402224122242222432224422245222462224722248222492225022251222522225322254222552225622257222582225922260222612226222263222642226522266222672226822269222702227122272222732227422275222762227722278222792228022281222822228322284222852228622287222882228922290222912229222293222942229522296222972229822299223002230122302223032230422305223062230722308223092231022311223122231322314223152231622317223182231922320223212232222323223242232522326223272232822329223302233122332223332233422335223362233722338223392234022341223422234322344223452234622347223482234922350223512235222353223542235522356223572235822359223602236122362223632236422365223662236722368223692237022371223722237322374223752237622377223782237922380223812238222383223842238522386223872238822389223902239122392223932239422395223962239722398223992240022401224022240322404224052240622407224082240922410224112241222413224142241522416224172241822419224202242122422224232242422425224262242722428224292243022431224322243322434224352243622437224382243922440224412244222443224442244522446224472244822449224502245122452224532245422455224562245722458224592246022461224622246322464224652246622467224682246922470224712247222473224742247522476224772247822479224802248122482224832248422485224862248722488224892249022491224922249322494224952249622497224982249922500225012250222503225042250522506225072250822509225102251122512225132251422515225162251722518225192252022521225222252322524225252252622527225282252922530225312253222533225342253522536225372253822539225402254122542225432254422545225462254722548225492255022551225522255322554225552255622557225582255922560225612256222563225642256522566225672256822569225702257122572225732257422575225762257722578225792258022581225822258322584225852258622587225882258922590225912259222593225942259522596225972259822599226002260122602226032260422605226062260722608226092261022611226122261322614226152261622617226182261922620226212262222623226242262522626226272262822629226302263122632226332263422635226362263722638226392264022641226422264322644226452264622647226482264922650226512265222653226542265522656226572265822659226602266122662226632266422665226662266722668226692267022671226722267322674226752267622677226782267922680226812268222683226842268522686226872268822689226902269122692226932269422695226962269722698226992270022701227022270322704227052270622707227082270922710227112271222713227142271522716227172271822719227202272122722227232272422725227262272722728227292273022731227322273322734227352273622737227382273922740227412274222743227442274522746227472274822749227502275122752227532275422755227562275722758227592276022761227622276322764227652276622767227682276922770227712277222773227742277522776227772277822779227802278122782227832278422785227862278722788227892279022791227922279322794227952279622797227982279922800228012280222803228042280522806228072280822809228102281122812228132281422815228162281722818228192282022821228222282322824228252282622827228282282922830228312283222833228342283522836228372283822839228402284122842228432284422845228462284722848228492285022851228522285322854228552285622857228582285922860228612286222863228642286522866228672286822869228702287122872228732287422875228762287722878228792288022881228822288322884228852288622887228882288922890228912289222893228942289522896228972289822899229002290122902229032290422905229062290722908229092291022911229122291322914229152291622917229182291922920229212292222923229242292522926229272292822929229302293122932229332293422935229362293722938229392294022941229422294322944229452294622947229482294922950229512295222953229542295522956229572295822959229602296122962229632296422965229662296722968229692297022971229722297322974229752297622977229782297922980229812298222983229842298522986229872298822989229902299122992229932299422995229962299722998229992300023001230022300323004230052300623007230082300923010230112301223013230142301523016230172301823019230202302123022230232302423025230262302723028230292303023031230322303323034230352303623037230382303923040230412304223043230442304523046230472304823049230502305123052230532305423055230562305723058230592306023061230622306323064230652306623067230682306923070230712307223073230742307523076230772307823079230802308123082230832308423085230862308723088230892309023091230922309323094230952309623097230982309923100231012310223103231042310523106231072310823109231102311123112231132311423115231162311723118231192312023121231222312323124231252312623127231282312923130231312313223133231342313523136231372313823139231402314123142231432314423145231462314723148231492315023151231522315323154231552315623157231582315923160231612316223163231642316523166231672316823169231702317123172231732317423175231762317723178231792318023181231822318323184231852318623187231882318923190231912319223193231942319523196231972319823199232002320123202232032320423205232062320723208232092321023211232122321323214232152321623217232182321923220232212322223223232242322523226232272322823229232302323123232232332323423235232362323723238232392324023241232422324323244232452324623247232482324923250232512325223253232542325523256232572325823259232602326123262232632326423265232662326723268232692327023271232722327323274232752327623277232782327923280232812328223283232842328523286232872328823289232902329123292232932329423295232962329723298232992330023301233022330323304233052330623307233082330923310233112331223313233142331523316233172331823319233202332123322233232332423325233262332723328233292333023331233322333323334233352333623337233382333923340233412334223343233442334523346233472334823349233502335123352233532335423355233562335723358233592336023361233622336323364233652336623367233682336923370233712337223373233742337523376233772337823379233802338123382233832338423385233862338723388233892339023391233922339323394233952339623397233982339923400234012340223403234042340523406234072340823409234102341123412234132341423415234162341723418234192342023421234222342323424234252342623427234282342923430234312343223433234342343523436234372343823439234402344123442234432344423445234462344723448234492345023451234522345323454234552345623457234582345923460234612346223463234642346523466234672346823469234702347123472234732347423475234762347723478234792348023481234822348323484234852348623487234882348923490234912349223493234942349523496234972349823499235002350123502235032350423505235062350723508235092351023511235122351323514235152351623517235182351923520235212352223523235242352523526235272352823529235302353123532235332353423535235362353723538235392354023541235422354323544235452354623547235482354923550235512355223553235542355523556235572355823559235602356123562235632356423565235662356723568235692357023571235722357323574235752357623577235782357923580235812358223583235842358523586235872358823589235902359123592235932359423595235962359723598235992360023601236022360323604236052360623607236082360923610236112361223613236142361523616236172361823619236202362123622236232362423625236262362723628236292363023631236322363323634236352363623637236382363923640236412364223643236442364523646236472364823649236502365123652236532365423655236562365723658236592366023661236622366323664236652366623667236682366923670236712367223673236742367523676236772367823679236802368123682236832368423685236862368723688236892369023691236922369323694236952369623697236982369923700237012370223703237042370523706237072370823709237102371123712237132371423715237162371723718237192372023721237222372323724237252372623727237282372923730237312373223733237342373523736237372373823739237402374123742237432374423745237462374723748237492375023751237522375323754237552375623757237582375923760237612376223763237642376523766237672376823769237702377123772237732377423775237762377723778237792378023781237822378323784237852378623787237882378923790237912379223793237942379523796237972379823799238002380123802238032380423805238062380723808238092381023811238122381323814238152381623817238182381923820238212382223823238242382523826238272382823829238302383123832238332383423835238362383723838238392384023841238422384323844238452384623847238482384923850238512385223853238542385523856238572385823859238602386123862238632386423865238662386723868238692387023871238722387323874238752387623877238782387923880238812388223883238842388523886238872388823889238902389123892238932389423895238962389723898238992390023901239022390323904239052390623907239082390923910239112391223913239142391523916239172391823919239202392123922239232392423925239262392723928239292393023931239322393323934239352393623937239382393923940239412394223943239442394523946239472394823949239502395123952239532395423955239562395723958239592396023961239622396323964239652396623967239682396923970239712397223973239742397523976239772397823979239802398123982239832398423985239862398723988239892399023991239922399323994239952399623997239982399924000240012400224003240042400524006240072400824009240102401124012240132401424015240162401724018240192402024021240222402324024240252402624027240282402924030240312403224033240342403524036240372403824039240402404124042240432404424045240462404724048240492405024051240522405324054240552405624057240582405924060240612406224063240642406524066240672406824069240702407124072240732407424075240762407724078240792408024081240822408324084240852408624087240882408924090240912409224093240942409524096240972409824099241002410124102241032410424105241062410724108241092411024111241122411324114241152411624117241182411924120241212412224123241242412524126241272412824129241302413124132241332413424135241362413724138241392414024141241422414324144241452414624147241482414924150241512415224153241542415524156241572415824159241602416124162241632416424165241662416724168241692417024171241722417324174241752417624177241782417924180241812418224183241842418524186241872418824189241902419124192241932419424195241962419724198241992420024201242022420324204242052420624207242082420924210242112421224213242142421524216242172421824219242202422124222242232422424225242262422724228242292423024231242322423324234242352423624237242382423924240242412424224243242442424524246242472424824249242502425124252242532425424255242562425724258242592426024261242622426324264242652426624267242682426924270242712427224273242742427524276242772427824279242802428124282242832428424285242862428724288242892429024291242922429324294242952429624297242982429924300243012430224303243042430524306243072430824309243102431124312243132431424315243162431724318243192432024321243222432324324243252432624327243282432924330243312433224333243342433524336243372433824339243402434124342243432434424345243462434724348243492435024351243522435324354243552435624357243582435924360243612436224363243642436524366243672436824369243702437124372243732437424375243762437724378243792438024381243822438324384243852438624387243882438924390243912439224393243942439524396243972439824399244002440124402244032440424405244062440724408244092441024411244122441324414244152441624417244182441924420244212442224423244242442524426244272442824429244302443124432244332443424435244362443724438244392444024441244422444324444244452444624447244482444924450244512445224453244542445524456244572445824459244602446124462244632446424465244662446724468244692447024471244722447324474244752447624477244782447924480244812448224483244842448524486244872448824489244902449124492244932449424495244962449724498244992450024501245022450324504245052450624507245082450924510245112451224513245142451524516245172451824519245202452124522245232452424525245262452724528245292453024531245322453324534245352453624537245382453924540245412454224543245442454524546245472454824549245502455124552245532455424555245562455724558245592456024561245622456324564245652456624567245682456924570245712457224573245742457524576245772457824579245802458124582245832458424585245862458724588245892459024591245922459324594245952459624597245982459924600246012460224603246042460524606246072460824609246102461124612246132461424615246162461724618246192462024621246222462324624246252462624627246282462924630246312463224633246342463524636246372463824639246402464124642246432464424645246462464724648246492465024651246522465324654246552465624657246582465924660246612466224663246642466524666246672466824669246702467124672246732467424675246762467724678246792468024681246822468324684246852468624687246882468924690246912469224693246942469524696246972469824699247002470124702247032470424705247062470724708247092471024711247122471324714247152471624717247182471924720247212472224723247242472524726247272472824729247302473124732247332473424735247362473724738247392474024741247422474324744247452474624747247482474924750247512475224753247542475524756247572475824759247602476124762247632476424765247662476724768247692477024771247722477324774247752477624777247782477924780247812478224783247842478524786247872478824789247902479124792247932479424795247962479724798247992480024801248022480324804248052480624807248082480924810248112481224813248142481524816248172481824819248202482124822248232482424825248262482724828248292483024831248322483324834248352483624837248382483924840248412484224843248442484524846248472484824849248502485124852248532485424855248562485724858248592486024861248622486324864248652486624867248682486924870248712487224873248742487524876248772487824879248802488124882248832488424885248862488724888248892489024891248922489324894248952489624897248982489924900249012490224903249042490524906249072490824909249102491124912249132491424915249162491724918249192492024921249222492324924249252492624927249282492924930249312493224933249342493524936249372493824939249402494124942249432494424945249462494724948249492495024951249522495324954249552495624957249582495924960249612496224963249642496524966249672496824969249702497124972249732497424975249762497724978249792498024981249822498324984249852498624987249882498924990249912499224993249942499524996249972499824999250002500125002250032500425005250062500725008250092501025011250122501325014250152501625017250182501925020250212502225023250242502525026250272502825029250302503125032250332503425035250362503725038250392504025041250422504325044250452504625047250482504925050250512505225053250542505525056250572505825059250602506125062250632506425065250662506725068250692507025071250722507325074250752507625077250782507925080250812508225083250842508525086250872508825089250902509125092250932509425095250962509725098250992510025101251022510325104251052510625107251082510925110251112511225113251142511525116251172511825119251202512125122251232512425125251262512725128251292513025131251322513325134251352513625137251382513925140251412514225143251442514525146251472514825149251502515125152251532515425155251562515725158251592516025161251622516325164251652516625167251682516925170251712517225173251742517525176251772517825179251802518125182251832518425185251862518725188251892519025191251922519325194251952519625197251982519925200252012520225203252042520525206252072520825209252102521125212252132521425215252162521725218252192522025221252222522325224252252522625227252282522925230252312523225233252342523525236252372523825239252402524125242252432524425245252462524725248252492525025251252522525325254252552525625257252582525925260252612526225263252642526525266252672526825269252702527125272252732527425275252762527725278252792528025281252822528325284252852528625287252882528925290252912529225293252942529525296252972529825299253002530125302253032530425305253062530725308253092531025311253122531325314253152531625317253182531925320253212532225323253242532525326253272532825329253302533125332253332533425335253362533725338253392534025341253422534325344253452534625347253482534925350253512535225353253542535525356253572535825359253602536125362253632536425365253662536725368253692537025371253722537325374253752537625377253782537925380253812538225383253842538525386253872538825389253902539125392253932539425395253962539725398253992540025401254022540325404254052540625407254082540925410254112541225413254142541525416254172541825419254202542125422254232542425425254262542725428254292543025431254322543325434254352543625437254382543925440254412544225443254442544525446254472544825449254502545125452254532545425455254562545725458254592546025461254622546325464254652546625467254682546925470254712547225473254742547525476254772547825479254802548125482254832548425485254862548725488254892549025491254922549325494254952549625497254982549925500255012550225503255042550525506255072550825509255102551125512255132551425515255162551725518255192552025521255222552325524255252552625527255282552925530255312553225533255342553525536255372553825539255402554125542255432554425545255462554725548255492555025551255522555325554255552555625557255582555925560255612556225563255642556525566255672556825569255702557125572255732557425575255762557725578255792558025581255822558325584255852558625587255882558925590255912559225593255942559525596255972559825599256002560125602256032560425605256062560725608256092561025611256122561325614256152561625617256182561925620256212562225623256242562525626256272562825629256302563125632256332563425635256362563725638256392564025641256422564325644256452564625647256482564925650256512565225653256542565525656256572565825659256602566125662256632566425665256662566725668256692567025671256722567325674256752567625677256782567925680256812568225683256842568525686256872568825689256902569125692256932569425695256962569725698256992570025701257022570325704257052570625707257082570925710257112571225713257142571525716257172571825719257202572125722257232572425725257262572725728257292573025731257322573325734257352573625737257382573925740257412574225743257442574525746257472574825749257502575125752257532575425755257562575725758257592576025761257622576325764257652576625767257682576925770257712577225773257742577525776257772577825779257802578125782257832578425785257862578725788257892579025791257922579325794257952579625797257982579925800258012580225803258042580525806258072580825809258102581125812258132581425815258162581725818258192582025821258222582325824258252582625827258282582925830258312583225833258342583525836258372583825839258402584125842258432584425845258462584725848258492585025851258522585325854258552585625857258582585925860258612586225863258642586525866258672586825869258702587125872258732587425875258762587725878258792588025881258822588325884258852588625887258882588925890258912589225893258942589525896258972589825899259002590125902259032590425905259062590725908259092591025911259122591325914259152591625917259182591925920259212592225923259242592525926259272592825929259302593125932259332593425935259362593725938259392594025941259422594325944259452594625947259482594925950259512595225953259542595525956259572595825959259602596125962259632596425965259662596725968259692597025971259722597325974259752597625977259782597925980259812598225983259842598525986259872598825989259902599125992259932599425995259962599725998259992600026001260022600326004260052600626007260082600926010260112601226013260142601526016260172601826019260202602126022260232602426025260262602726028260292603026031260322603326034260352603626037260382603926040260412604226043260442604526046260472604826049260502605126052260532605426055260562605726058260592606026061260622606326064260652606626067260682606926070260712607226073260742607526076260772607826079260802608126082260832608426085260862608726088260892609026091260922609326094260952609626097260982609926100261012610226103261042610526106261072610826109261102611126112261132611426115261162611726118261192612026121261222612326124261252612626127261282612926130261312613226133261342613526136261372613826139261402614126142261432614426145261462614726148261492615026151261522615326154261552615626157261582615926160261612616226163261642616526166261672616826169261702617126172261732617426175261762617726178261792618026181261822618326184261852618626187261882618926190261912619226193261942619526196261972619826199262002620126202262032620426205262062620726208262092621026211262122621326214262152621626217262182621926220262212622226223262242622526226262272622826229262302623126232262332623426235262362623726238262392624026241262422624326244262452624626247262482624926250262512625226253262542625526256262572625826259262602626126262262632626426265262662626726268262692627026271262722627326274262752627626277262782627926280262812628226283262842628526286262872628826289262902629126292262932629426295262962629726298262992630026301263022630326304263052630626307263082630926310263112631226313263142631526316263172631826319263202632126322263232632426325263262632726328263292633026331263322633326334263352633626337263382633926340263412634226343263442634526346263472634826349263502635126352263532635426355263562635726358263592636026361263622636326364263652636626367263682636926370263712637226373263742637526376263772637826379263802638126382263832638426385263862638726388263892639026391263922639326394263952639626397263982639926400264012640226403264042640526406264072640826409264102641126412264132641426415264162641726418264192642026421264222642326424264252642626427264282642926430264312643226433264342643526436264372643826439264402644126442264432644426445264462644726448264492645026451264522645326454264552645626457264582645926460264612646226463264642646526466264672646826469264702647126472264732647426475264762647726478264792648026481264822648326484264852648626487264882648926490264912649226493264942649526496264972649826499265002650126502265032650426505265062650726508265092651026511265122651326514265152651626517265182651926520265212652226523265242652526526265272652826529265302653126532265332653426535265362653726538265392654026541265422654326544265452654626547265482654926550265512655226553265542655526556265572655826559265602656126562265632656426565265662656726568265692657026571265722657326574265752657626577265782657926580265812658226583265842658526586265872658826589265902659126592265932659426595265962659726598265992660026601266022660326604266052660626607266082660926610266112661226613266142661526616266172661826619266202662126622266232662426625266262662726628266292663026631266322663326634266352663626637266382663926640266412664226643266442664526646266472664826649266502665126652266532665426655266562665726658266592666026661266622666326664266652666626667266682666926670266712667226673266742667526676266772667826679266802668126682266832668426685266862668726688266892669026691266922669326694266952669626697266982669926700267012670226703267042670526706267072670826709267102671126712267132671426715267162671726718267192672026721267222672326724267252672626727267282672926730267312673226733267342673526736267372673826739267402674126742267432674426745267462674726748267492675026751267522675326754267552675626757267582675926760267612676226763267642676526766267672676826769267702677126772267732677426775267762677726778267792678026781267822678326784267852678626787267882678926790267912679226793267942679526796267972679826799268002680126802268032680426805268062680726808268092681026811268122681326814268152681626817268182681926820268212682226823268242682526826268272682826829268302683126832268332683426835268362683726838268392684026841268422684326844268452684626847268482684926850268512685226853268542685526856268572685826859268602686126862268632686426865268662686726868268692687026871268722687326874268752687626877268782687926880268812688226883268842688526886268872688826889268902689126892268932689426895268962689726898268992690026901269022690326904269052690626907269082690926910269112691226913269142691526916269172691826919269202692126922269232692426925269262692726928269292693026931269322693326934269352693626937269382693926940269412694226943269442694526946269472694826949269502695126952269532695426955269562695726958269592696026961269622696326964269652696626967269682696926970269712697226973269742697526976269772697826979269802698126982269832698426985269862698726988269892699026991269922699326994269952699626997269982699927000270012700227003270042700527006270072700827009270102701127012270132701427015270162701727018270192702027021270222702327024270252702627027270282702927030270312703227033270342703527036270372703827039270402704127042270432704427045270462704727048270492705027051270522705327054270552705627057270582705927060270612706227063270642706527066270672706827069270702707127072270732707427075270762707727078270792708027081270822708327084270852708627087270882708927090270912709227093270942709527096270972709827099271002710127102271032710427105271062710727108271092711027111271122711327114271152711627117271182711927120271212712227123271242712527126271272712827129271302713127132271332713427135271362713727138271392714027141271422714327144271452714627147271482714927150271512715227153271542715527156271572715827159271602716127162271632716427165271662716727168271692717027171271722717327174271752717627177271782717927180271812718227183271842718527186271872718827189271902719127192271932719427195271962719727198271992720027201272022720327204272052720627207272082720927210272112721227213272142721527216272172721827219272202722127222272232722427225272262722727228272292723027231272322723327234272352723627237272382723927240272412724227243272442724527246272472724827249272502725127252272532725427255272562725727258272592726027261272622726327264272652726627267272682726927270272712727227273272742727527276272772727827279272802728127282272832728427285272862728727288272892729027291272922729327294272952729627297272982729927300273012730227303273042730527306273072730827309273102731127312273132731427315273162731727318273192732027321273222732327324273252732627327273282732927330273312733227333273342733527336273372733827339273402734127342273432734427345273462734727348273492735027351273522735327354273552735627357273582735927360273612736227363273642736527366273672736827369273702737127372273732737427375273762737727378273792738027381273822738327384273852738627387273882738927390273912739227393273942739527396273972739827399274002740127402274032740427405274062740727408274092741027411274122741327414274152741627417274182741927420274212742227423274242742527426274272742827429274302743127432274332743427435274362743727438274392744027441274422744327444274452744627447274482744927450274512745227453274542745527456274572745827459274602746127462274632746427465274662746727468274692747027471274722747327474274752747627477274782747927480274812748227483274842748527486274872748827489274902749127492274932749427495274962749727498274992750027501275022750327504275052750627507275082750927510275112751227513275142751527516275172751827519275202752127522275232752427525275262752727528275292753027531275322753327534275352753627537275382753927540275412754227543275442754527546275472754827549275502755127552275532755427555275562755727558275592756027561275622756327564275652756627567275682756927570275712757227573275742757527576275772757827579275802758127582275832758427585275862758727588275892759027591275922759327594275952759627597275982759927600276012760227603276042760527606276072760827609276102761127612276132761427615276162761727618276192762027621276222762327624276252762627627276282762927630276312763227633276342763527636276372763827639276402764127642276432764427645276462764727648276492765027651276522765327654276552765627657276582765927660276612766227663276642766527666276672766827669276702767127672276732767427675276762767727678276792768027681276822768327684276852768627687276882768927690276912769227693276942769527696276972769827699277002770127702277032770427705277062770727708277092771027711277122771327714277152771627717277182771927720277212772227723277242772527726277272772827729277302773127732277332773427735277362773727738277392774027741277422774327744277452774627747277482774927750277512775227753277542775527756277572775827759277602776127762277632776427765277662776727768277692777027771277722777327774277752777627777277782777927780277812778227783277842778527786277872778827789277902779127792277932779427795277962779727798277992780027801278022780327804278052780627807278082780927810278112781227813278142781527816278172781827819278202782127822278232782427825278262782727828278292783027831278322783327834278352783627837278382783927840278412784227843278442784527846278472784827849278502785127852278532785427855278562785727858278592786027861278622786327864278652786627867278682786927870278712787227873278742787527876278772787827879278802788127882278832788427885278862788727888278892789027891278922789327894278952789627897278982789927900279012790227903279042790527906279072790827909279102791127912279132791427915279162791727918279192792027921279222792327924279252792627927279282792927930279312793227933279342793527936279372793827939279402794127942279432794427945279462794727948279492795027951279522795327954279552795627957279582795927960279612796227963279642796527966279672796827969279702797127972279732797427975279762797727978279792798027981279822798327984279852798627987279882798927990279912799227993279942799527996279972799827999280002800128002280032800428005280062800728008280092801028011280122801328014280152801628017280182801928020280212802228023280242802528026280272802828029280302803128032280332803428035280362803728038280392804028041280422804328044280452804628047280482804928050280512805228053280542805528056280572805828059280602806128062280632806428065280662806728068280692807028071280722807328074280752807628077280782807928080280812808228083280842808528086280872808828089280902809128092280932809428095280962809728098280992810028101281022810328104281052810628107281082810928110281112811228113281142811528116281172811828119281202812128122281232812428125281262812728128281292813028131281322813328134281352813628137281382813928140281412814228143281442814528146281472814828149281502815128152281532815428155281562815728158281592816028161281622816328164281652816628167281682816928170281712817228173281742817528176281772817828179281802818128182281832818428185281862818728188281892819028191281922819328194281952819628197281982819928200282012820228203282042820528206282072820828209282102821128212282132821428215282162821728218282192822028221282222822328224282252822628227282282822928230282312823228233282342823528236282372823828239282402824128242282432824428245282462824728248282492825028251282522825328254282552825628257282582825928260282612826228263282642826528266282672826828269282702827128272282732827428275282762827728278282792828028281282822828328284282852828628287282882828928290282912829228293282942829528296282972829828299283002830128302283032830428305283062830728308283092831028311283122831328314283152831628317283182831928320283212832228323283242832528326283272832828329283302833128332283332833428335283362833728338283392834028341283422834328344283452834628347283482834928350283512835228353283542835528356283572835828359283602836128362283632836428365283662836728368283692837028371283722837328374283752837628377283782837928380283812838228383283842838528386283872838828389283902839128392283932839428395283962839728398283992840028401284022840328404284052840628407284082840928410284112841228413284142841528416284172841828419284202842128422284232842428425284262842728428284292843028431284322843328434284352843628437284382843928440284412844228443284442844528446284472844828449284502845128452284532845428455284562845728458284592846028461284622846328464284652846628467284682846928470284712847228473284742847528476284772847828479284802848128482284832848428485284862848728488284892849028491284922849328494284952849628497284982849928500285012850228503285042850528506285072850828509285102851128512285132851428515285162851728518285192852028521285222852328524285252852628527285282852928530285312853228533285342853528536285372853828539285402854128542285432854428545285462854728548285492855028551285522855328554285552855628557285582855928560285612856228563285642856528566285672856828569285702857128572285732857428575285762857728578285792858028581285822858328584285852858628587285882858928590285912859228593285942859528596285972859828599286002860128602286032860428605286062860728608286092861028611286122861328614286152861628617286182861928620286212862228623286242862528626286272862828629286302863128632286332863428635286362863728638286392864028641286422864328644286452864628647286482864928650286512865228653286542865528656286572865828659286602866128662286632866428665286662866728668286692867028671286722867328674286752867628677286782867928680286812868228683286842868528686286872868828689286902869128692286932869428695286962869728698286992870028701287022870328704287052870628707287082870928710287112871228713287142871528716287172871828719287202872128722287232872428725287262872728728287292873028731287322873328734287352873628737287382873928740287412874228743287442874528746287472874828749287502875128752287532875428755287562875728758287592876028761287622876328764287652876628767287682876928770287712877228773287742877528776287772877828779287802878128782287832878428785287862878728788287892879028791287922879328794287952879628797287982879928800288012880228803288042880528806288072880828809288102881128812288132881428815288162881728818288192882028821288222882328824288252882628827288282882928830288312883228833288342883528836288372883828839288402884128842288432884428845288462884728848288492885028851288522885328854288552885628857288582885928860288612886228863288642886528866288672886828869288702887128872288732887428875288762887728878288792888028881288822888328884288852888628887288882888928890288912889228893288942889528896288972889828899289002890128902289032890428905289062890728908289092891028911289122891328914289152891628917289182891928920289212892228923289242892528926289272892828929289302893128932289332893428935289362893728938289392894028941289422894328944289452894628947289482894928950289512895228953289542895528956289572895828959289602896128962289632896428965289662896728968289692897028971289722897328974289752897628977289782897928980289812898228983289842898528986289872898828989289902899128992289932899428995289962899728998289992900029001290022900329004290052900629007290082900929010290112901229013290142901529016290172901829019290202902129022290232902429025290262902729028290292903029031290322903329034290352903629037290382903929040290412904229043290442904529046290472904829049290502905129052290532905429055290562905729058290592906029061290622906329064290652906629067290682906929070290712907229073290742907529076290772907829079290802908129082290832908429085290862908729088290892909029091290922909329094290952909629097290982909929100291012910229103291042910529106291072910829109291102911129112291132911429115291162911729118291192912029121291222912329124291252912629127291282912929130291312913229133291342913529136291372913829139291402914129142291432914429145291462914729148291492915029151291522915329154291552915629157291582915929160291612916229163291642916529166291672916829169291702917129172291732917429175291762917729178291792918029181291822918329184291852918629187291882918929190291912919229193291942919529196291972919829199292002920129202292032920429205292062920729208292092921029211292122921329214292152921629217292182921929220292212922229223292242922529226292272922829229292302923129232292332923429235292362923729238292392924029241292422924329244292452924629247292482924929250292512925229253292542925529256292572925829259292602926129262292632926429265292662926729268292692927029271292722927329274292752927629277292782927929280292812928229283292842928529286292872928829289292902929129292292932929429295292962929729298292992930029301293022930329304293052930629307293082930929310293112931229313293142931529316293172931829319293202932129322293232932429325293262932729328293292933029331293322933329334293352933629337293382933929340293412934229343293442934529346293472934829349293502935129352293532935429355293562935729358293592936029361293622936329364293652936629367293682936929370293712937229373293742937529376293772937829379293802938129382293832938429385293862938729388293892939029391293922939329394293952939629397293982939929400294012940229403294042940529406294072940829409294102941129412294132941429415294162941729418294192942029421294222942329424294252942629427294282942929430294312943229433294342943529436294372943829439294402944129442294432944429445294462944729448294492945029451294522945329454294552945629457294582945929460294612946229463294642946529466294672946829469294702947129472294732947429475294762947729478294792948029481294822948329484294852948629487294882948929490294912949229493294942949529496294972949829499295002950129502295032950429505295062950729508295092951029511295122951329514295152951629517295182951929520295212952229523295242952529526295272952829529295302953129532295332953429535295362953729538295392954029541295422954329544295452954629547295482954929550295512955229553295542955529556295572955829559295602956129562295632956429565295662956729568295692957029571295722957329574295752957629577295782957929580295812958229583295842958529586295872958829589295902959129592295932959429595295962959729598295992960029601296022960329604296052960629607296082960929610296112961229613296142961529616296172961829619296202962129622296232962429625296262962729628296292963029631296322963329634296352963629637296382963929640296412964229643296442964529646296472964829649296502965129652296532965429655296562965729658296592966029661296622966329664296652966629667296682966929670296712967229673296742967529676296772967829679296802968129682296832968429685296862968729688296892969029691296922969329694296952969629697296982969929700297012970229703297042970529706297072970829709297102971129712297132971429715297162971729718297192972029721297222972329724297252972629727297282972929730297312973229733297342973529736297372973829739297402974129742297432974429745297462974729748297492975029751297522975329754297552975629757297582975929760297612976229763297642976529766297672976829769297702977129772297732977429775297762977729778297792978029781297822978329784297852978629787297882978929790297912979229793297942979529796297972979829799298002980129802298032980429805298062980729808298092981029811298122981329814298152981629817298182981929820298212982229823298242982529826298272982829829298302983129832298332983429835298362983729838298392984029841298422984329844298452984629847298482984929850298512985229853298542985529856298572985829859298602986129862298632986429865298662986729868298692987029871298722987329874298752987629877298782987929880298812988229883298842988529886298872988829889298902989129892298932989429895298962989729898298992990029901299022990329904299052990629907299082990929910299112991229913299142991529916299172991829919299202992129922299232992429925299262992729928299292993029931299322993329934299352993629937299382993929940299412994229943299442994529946299472994829949299502995129952299532995429955299562995729958299592996029961299622996329964299652996629967299682996929970299712997229973299742997529976299772997829979299802998129982299832998429985299862998729988299892999029991299922999329994299952999629997299982999930000300013000230003300043000530006300073000830009300103001130012300133001430015300163001730018300193002030021300223002330024300253002630027300283002930030300313003230033300343003530036300373003830039300403004130042300433004430045300463004730048300493005030051300523005330054300553005630057300583005930060300613006230063300643006530066300673006830069300703007130072300733007430075300763007730078300793008030081300823008330084300853008630087300883008930090300913009230093300943009530096300973009830099301003010130102301033010430105301063010730108301093011030111301123011330114301153011630117301183011930120301213012230123301243012530126301273012830129301303013130132301333013430135301363013730138301393014030141301423014330144301453014630147301483014930150301513015230153301543015530156301573015830159301603016130162301633016430165301663016730168301693017030171301723017330174301753017630177301783017930180301813018230183301843018530186301873018830189301903019130192301933019430195301963019730198301993020030201302023020330204302053020630207302083020930210302113021230213302143021530216302173021830219302203022130222302233022430225302263022730228302293023030231302323023330234302353023630237302383023930240302413024230243302443024530246302473024830249302503025130252302533025430255302563025730258302593026030261302623026330264302653026630267302683026930270302713027230273302743027530276302773027830279302803028130282302833028430285302863028730288302893029030291302923029330294302953029630297302983029930300303013030230303303043030530306303073030830309303103031130312303133031430315303163031730318303193032030321303223032330324303253032630327303283032930330303313033230333303343033530336303373033830339303403034130342303433034430345303463034730348303493035030351303523035330354303553035630357303583035930360303613036230363303643036530366303673036830369303703037130372303733037430375303763037730378303793038030381303823038330384303853038630387303883038930390303913039230393303943039530396303973039830399304003040130402304033040430405304063040730408304093041030411304123041330414304153041630417304183041930420304213042230423304243042530426304273042830429304303043130432304333043430435304363043730438304393044030441304423044330444304453044630447304483044930450304513045230453304543045530456304573045830459304603046130462304633046430465304663046730468304693047030471304723047330474304753047630477304783047930480304813048230483304843048530486304873048830489304903049130492304933049430495304963049730498304993050030501305023050330504305053050630507305083050930510305113051230513305143051530516305173051830519305203052130522305233052430525305263052730528305293053030531305323053330534305353053630537305383053930540305413054230543305443054530546305473054830549305503055130552305533055430555305563055730558305593056030561305623056330564305653056630567305683056930570305713057230573305743057530576305773057830579305803058130582305833058430585305863058730588305893059030591305923059330594305953059630597305983059930600306013060230603306043060530606306073060830609306103061130612306133061430615306163061730618306193062030621306223062330624306253062630627306283062930630306313063230633306343063530636306373063830639306403064130642306433064430645306463064730648306493065030651306523065330654306553065630657306583065930660306613066230663306643066530666306673066830669306703067130672306733067430675306763067730678306793068030681306823068330684306853068630687306883068930690306913069230693306943069530696306973069830699307003070130702307033070430705307063070730708307093071030711307123071330714307153071630717307183071930720307213072230723307243072530726307273072830729307303073130732307333073430735307363073730738307393074030741307423074330744307453074630747307483074930750307513075230753307543075530756307573075830759307603076130762307633076430765307663076730768307693077030771307723077330774307753077630777307783077930780307813078230783307843078530786307873078830789307903079130792307933079430795307963079730798307993080030801308023080330804308053080630807308083080930810308113081230813308143081530816308173081830819308203082130822308233082430825308263082730828308293083030831308323083330834308353083630837308383083930840308413084230843308443084530846308473084830849308503085130852308533085430855308563085730858308593086030861308623086330864308653086630867308683086930870308713087230873308743087530876308773087830879308803088130882308833088430885308863088730888308893089030891308923089330894308953089630897308983089930900309013090230903309043090530906309073090830909309103091130912309133091430915309163091730918309193092030921309223092330924309253092630927309283092930930309313093230933309343093530936309373093830939309403094130942309433094430945309463094730948309493095030951309523095330954309553095630957309583095930960309613096230963309643096530966309673096830969309703097130972309733097430975309763097730978309793098030981309823098330984309853098630987309883098930990309913099230993309943099530996309973099830999310003100131002310033100431005310063100731008310093101031011310123101331014310153101631017310183101931020310213102231023310243102531026310273102831029310303103131032310333103431035310363103731038310393104031041310423104331044310453104631047310483104931050310513105231053310543105531056310573105831059310603106131062310633106431065310663106731068310693107031071310723107331074310753107631077310783107931080310813108231083310843108531086310873108831089310903109131092310933109431095310963109731098310993110031101311023110331104311053110631107311083110931110311113111231113311143111531116311173111831119311203112131122311233112431125311263112731128311293113031131311323113331134311353113631137311383113931140311413114231143311443114531146311473114831149311503115131152311533115431155311563115731158311593116031161311623116331164311653116631167311683116931170311713117231173311743117531176311773117831179311803118131182311833118431185311863118731188311893119031191311923119331194311953119631197311983119931200312013120231203312043120531206312073120831209312103121131212312133121431215312163121731218312193122031221312223122331224312253122631227312283122931230312313123231233312343123531236312373123831239312403124131242312433124431245312463124731248312493125031251312523125331254312553125631257312583125931260312613126231263312643126531266312673126831269312703127131272312733127431275312763127731278312793128031281312823128331284312853128631287312883128931290312913129231293312943129531296312973129831299313003130131302313033130431305313063130731308313093131031311313123131331314313153131631317313183131931320313213132231323313243132531326313273132831329313303133131332313333133431335313363133731338313393134031341313423134331344313453134631347313483134931350313513135231353313543135531356313573135831359313603136131362313633136431365313663136731368313693137031371313723137331374313753137631377313783137931380313813138231383313843138531386313873138831389313903139131392313933139431395313963139731398313993140031401314023140331404314053140631407314083140931410314113141231413314143141531416314173141831419314203142131422314233142431425314263142731428314293143031431314323143331434314353143631437314383143931440314413144231443314443144531446314473144831449314503145131452314533145431455314563145731458314593146031461314623146331464314653146631467314683146931470314713147231473314743147531476314773147831479314803148131482314833148431485314863148731488314893149031491314923149331494314953149631497314983149931500315013150231503315043150531506315073150831509315103151131512315133151431515315163151731518315193152031521315223152331524315253152631527315283152931530315313153231533315343153531536315373153831539315403154131542315433154431545315463154731548315493155031551315523155331554315553155631557315583155931560315613156231563315643156531566315673156831569315703157131572315733157431575315763157731578315793158031581315823158331584315853158631587315883158931590315913159231593315943159531596315973159831599316003160131602316033160431605316063160731608316093161031611316123161331614316153161631617316183161931620316213162231623316243162531626316273162831629316303163131632316333163431635316363163731638316393164031641316423164331644316453164631647316483164931650316513165231653316543165531656316573165831659316603166131662316633166431665316663166731668316693167031671316723167331674316753167631677316783167931680316813168231683316843168531686316873168831689316903169131692316933169431695316963169731698316993170031701317023170331704317053170631707317083170931710317113171231713317143171531716317173171831719317203172131722317233172431725317263172731728317293173031731317323173331734317353173631737317383173931740317413174231743317443174531746317473174831749317503175131752317533175431755317563175731758317593176031761317623176331764317653176631767317683176931770317713177231773317743177531776317773177831779317803178131782317833178431785317863178731788317893179031791317923179331794317953179631797317983179931800318013180231803318043180531806318073180831809318103181131812318133181431815318163181731818318193182031821318223182331824318253182631827318283182931830318313183231833318343183531836318373183831839318403184131842318433184431845318463184731848318493185031851318523185331854318553185631857318583185931860318613186231863318643186531866318673186831869318703187131872318733187431875318763187731878318793188031881318823188331884318853188631887318883188931890318913189231893318943189531896318973189831899319003190131902319033190431905319063190731908319093191031911319123191331914319153191631917319183191931920319213192231923319243192531926319273192831929319303193131932319333193431935319363193731938319393194031941319423194331944319453194631947319483194931950319513195231953319543195531956319573195831959319603196131962319633196431965319663196731968319693197031971319723197331974319753197631977319783197931980319813198231983319843198531986319873198831989319903199131992319933199431995319963199731998319993200032001320023200332004320053200632007320083200932010320113201232013320143201532016320173201832019320203202132022320233202432025320263202732028320293203032031320323203332034320353203632037320383203932040320413204232043320443204532046320473204832049320503205132052320533205432055320563205732058320593206032061320623206332064320653206632067320683206932070320713207232073320743207532076320773207832079320803208132082320833208432085320863208732088320893209032091320923209332094320953209632097320983209932100321013210232103321043210532106321073210832109321103211132112321133211432115321163211732118321193212032121321223212332124321253212632127321283212932130321313213232133321343213532136321373213832139321403214132142321433214432145321463214732148321493215032151321523215332154321553215632157321583215932160321613216232163321643216532166321673216832169321703217132172321733217432175321763217732178321793218032181321823218332184321853218632187321883218932190321913219232193321943219532196321973219832199322003220132202322033220432205322063220732208322093221032211322123221332214322153221632217322183221932220322213222232223322243222532226322273222832229322303223132232322333223432235322363223732238322393224032241322423224332244322453224632247322483224932250322513225232253322543225532256322573225832259322603226132262322633226432265322663226732268322693227032271322723227332274322753227632277322783227932280322813228232283322843228532286322873228832289322903229132292322933229432295322963229732298322993230032301323023230332304323053230632307323083230932310323113231232313323143231532316323173231832319323203232132322323233232432325323263232732328323293233032331323323233332334323353233632337323383233932340323413234232343323443234532346323473234832349323503235132352323533235432355323563235732358323593236032361323623236332364323653236632367323683236932370323713237232373323743237532376323773237832379323803238132382323833238432385323863238732388323893239032391323923239332394323953239632397323983239932400324013240232403324043240532406324073240832409324103241132412324133241432415324163241732418324193242032421324223242332424324253242632427324283242932430324313243232433324343243532436324373243832439324403244132442324433244432445324463244732448324493245032451324523245332454324553245632457324583245932460324613246232463324643246532466324673246832469324703247132472324733247432475324763247732478324793248032481324823248332484324853248632487324883248932490324913249232493324943249532496324973249832499325003250132502325033250432505325063250732508325093251032511325123251332514325153251632517325183251932520325213252232523325243252532526325273252832529325303253132532325333253432535325363253732538325393254032541325423254332544325453254632547325483254932550325513255232553325543255532556325573255832559325603256132562325633256432565325663256732568325693257032571325723257332574325753257632577325783257932580325813258232583325843258532586325873258832589325903259132592325933259432595325963259732598325993260032601326023260332604326053260632607326083260932610326113261232613326143261532616326173261832619326203262132622326233262432625326263262732628326293263032631326323263332634326353263632637326383263932640326413264232643326443264532646326473264832649326503265132652326533265432655326563265732658326593266032661326623266332664326653266632667326683266932670326713267232673326743267532676326773267832679326803268132682326833268432685326863268732688326893269032691326923269332694326953269632697326983269932700327013270232703327043270532706327073270832709327103271132712327133271432715327163271732718327193272032721327223272332724327253272632727327283272932730327313273232733327343273532736327373273832739327403274132742327433274432745327463274732748327493275032751327523275332754327553275632757327583275932760327613276232763327643276532766327673276832769327703277132772327733277432775327763277732778327793278032781327823278332784327853278632787327883278932790327913279232793327943279532796327973279832799328003280132802328033280432805328063280732808328093281032811328123281332814328153281632817328183281932820328213282232823328243282532826328273282832829328303283132832328333283432835328363283732838328393284032841328423284332844328453284632847328483284932850328513285232853328543285532856328573285832859328603286132862328633286432865328663286732868328693287032871328723287332874328753287632877328783287932880328813288232883328843288532886328873288832889328903289132892328933289432895328963289732898328993290032901329023290332904329053290632907329083290932910329113291232913329143291532916329173291832919329203292132922329233292432925329263292732928329293293032931329323293332934329353293632937329383293932940329413294232943329443294532946329473294832949329503295132952329533295432955329563295732958329593296032961329623296332964329653296632967329683296932970329713297232973329743297532976329773297832979329803298132982329833298432985329863298732988329893299032991329923299332994329953299632997329983299933000330013300233003330043300533006330073300833009330103301133012330133301433015330163301733018330193302033021330223302333024330253302633027330283302933030330313303233033330343303533036330373303833039330403304133042330433304433045330463304733048330493305033051330523305333054330553305633057330583305933060330613306233063330643306533066330673306833069330703307133072330733307433075330763307733078330793308033081330823308333084330853308633087330883308933090330913309233093330943309533096330973309833099331003310133102331033310433105331063310733108331093311033111331123311333114331153311633117331183311933120331213312233123331243312533126331273312833129331303313133132331333313433135331363313733138331393314033141331423314333144331453314633147331483314933150331513315233153331543315533156331573315833159331603316133162331633316433165331663316733168331693317033171331723317333174331753317633177331783317933180331813318233183331843318533186331873318833189331903319133192331933319433195331963319733198331993320033201332023320333204332053320633207332083320933210332113321233213332143321533216332173321833219332203322133222332233322433225332263322733228332293323033231332323323333234332353323633237332383323933240332413324233243332443324533246332473324833249332503325133252332533325433255332563325733258332593326033261332623326333264332653326633267332683326933270332713327233273332743327533276332773327833279332803328133282332833328433285332863328733288332893329033291332923329333294332953329633297332983329933300333013330233303333043330533306333073330833309333103331133312333133331433315333163331733318333193332033321333223332333324333253332633327333283332933330333313333233333333343333533336333373333833339333403334133342333433334433345333463334733348333493335033351333523335333354333553335633357333583335933360333613336233363333643336533366333673336833369333703337133372333733337433375333763337733378333793338033381333823338333384333853338633387333883338933390333913339233393333943339533396333973339833399334003340133402334033340433405334063340733408334093341033411334123341333414334153341633417334183341933420334213342233423334243342533426334273342833429334303343133432334333343433435334363343733438334393344033441334423344333444334453344633447334483344933450334513345233453334543345533456334573345833459334603346133462334633346433465334663346733468334693347033471334723347333474334753347633477334783347933480334813348233483334843348533486334873348833489334903349133492334933349433495334963349733498334993350033501335023350333504335053350633507335083350933510335113351233513335143351533516335173351833519335203352133522335233352433525335263352733528335293353033531335323353333534335353353633537335383353933540335413354233543335443354533546335473354833549335503355133552335533355433555335563355733558335593356033561335623356333564335653356633567335683356933570335713357233573335743357533576335773357833579335803358133582335833358433585335863358733588335893359033591335923359333594335953359633597335983359933600336013360233603336043360533606336073360833609336103361133612336133361433615336163361733618336193362033621336223362333624336253362633627336283362933630336313363233633336343363533636336373363833639336403364133642336433364433645336463364733648336493365033651336523365333654336553365633657336583365933660336613366233663336643366533666336673366833669336703367133672336733367433675336763367733678336793368033681336823368333684336853368633687336883368933690336913369233693336943369533696336973369833699337003370133702337033370433705337063370733708337093371033711337123371333714337153371633717337183371933720337213372233723337243372533726337273372833729337303373133732337333373433735337363373733738337393374033741337423374333744337453374633747337483374933750337513375233753337543375533756337573375833759337603376133762337633376433765337663376733768337693377033771337723377333774337753377633777337783377933780337813378233783337843378533786337873378833789337903379133792337933379433795337963379733798337993380033801338023380333804338053380633807338083380933810338113381233813338143381533816338173381833819338203382133822338233382433825338263382733828338293383033831338323383333834338353383633837338383383933840338413384233843338443384533846338473384833849338503385133852338533385433855338563385733858338593386033861338623386333864338653386633867338683386933870338713387233873338743387533876338773387833879338803388133882338833388433885338863388733888338893389033891338923389333894338953389633897338983389933900339013390233903339043390533906339073390833909339103391133912339133391433915339163391733918339193392033921339223392333924339253392633927339283392933930339313393233933339343393533936339373393833939339403394133942339433394433945339463394733948339493395033951339523395333954339553395633957339583395933960339613396233963339643396533966339673396833969339703397133972339733397433975339763397733978339793398033981339823398333984339853398633987339883398933990339913399233993339943399533996339973399833999340003400134002340033400434005340063400734008340093401034011340123401334014340153401634017340183401934020340213402234023340243402534026340273402834029340303403134032340333403434035340363403734038340393404034041340423404334044340453404634047340483404934050340513405234053340543405534056340573405834059340603406134062340633406434065340663406734068340693407034071340723407334074340753407634077340783407934080340813408234083340843408534086340873408834089340903409134092340933409434095340963409734098340993410034101341023410334104341053410634107341083410934110341113411234113341143411534116341173411834119341203412134122341233412434125341263412734128341293413034131341323413334134341353413634137341383413934140341413414234143341443414534146341473414834149341503415134152341533415434155341563415734158341593416034161341623416334164341653416634167341683416934170341713417234173341743417534176341773417834179341803418134182341833418434185341863418734188341893419034191341923419334194341953419634197341983419934200342013420234203342043420534206342073420834209342103421134212342133421434215342163421734218342193422034221342223422334224342253422634227342283422934230342313423234233342343423534236342373423834239342403424134242342433424434245342463424734248342493425034251342523425334254342553425634257342583425934260342613426234263342643426534266342673426834269342703427134272342733427434275342763427734278342793428034281342823428334284342853428634287342883428934290342913429234293342943429534296342973429834299343003430134302343033430434305343063430734308343093431034311343123431334314343153431634317343183431934320343213432234323343243432534326343273432834329343303433134332343333433434335343363433734338343393434034341343423434334344343453434634347343483434934350343513435234353343543435534356343573435834359343603436134362343633436434365343663436734368343693437034371343723437334374343753437634377343783437934380343813438234383343843438534386343873438834389343903439134392343933439434395343963439734398343993440034401344023440334404344053440634407344083440934410344113441234413344143441534416344173441834419344203442134422344233442434425344263442734428344293443034431344323443334434344353443634437344383443934440344413444234443344443444534446344473444834449344503445134452344533445434455344563445734458344593446034461344623446334464344653446634467344683446934470344713447234473344743447534476344773447834479344803448134482344833448434485344863448734488344893449034491344923449334494344953449634497344983449934500345013450234503345043450534506345073450834509345103451134512345133451434515345163451734518345193452034521345223452334524345253452634527345283452934530345313453234533345343453534536345373453834539345403454134542345433454434545345463454734548345493455034551345523455334554345553455634557345583455934560345613456234563345643456534566345673456834569345703457134572345733457434575345763457734578345793458034581345823458334584345853458634587345883458934590345913459234593345943459534596345973459834599346003460134602346033460434605346063460734608346093461034611346123461334614346153461634617346183461934620346213462234623346243462534626346273462834629346303463134632346333463434635346363463734638346393464034641346423464334644346453464634647346483464934650346513465234653346543465534656346573465834659346603466134662346633466434665346663466734668346693467034671346723467334674346753467634677346783467934680346813468234683346843468534686346873468834689346903469134692346933469434695346963469734698346993470034701347023470334704347053470634707347083470934710347113471234713347143471534716347173471834719347203472134722347233472434725347263472734728347293473034731347323473334734347353473634737347383473934740347413474234743347443474534746347473474834749347503475134752347533475434755347563475734758347593476034761347623476334764347653476634767347683476934770347713477234773347743477534776347773477834779347803478134782347833478434785347863478734788347893479034791347923479334794347953479634797347983479934800348013480234803348043480534806348073480834809348103481134812348133481434815348163481734818348193482034821348223482334824348253482634827348283482934830348313483234833348343483534836348373483834839348403484134842348433484434845348463484734848348493485034851348523485334854348553485634857348583485934860348613486234863348643486534866348673486834869348703487134872348733487434875348763487734878348793488034881348823488334884348853488634887348883488934890348913489234893348943489534896348973489834899349003490134902349033490434905349063490734908349093491034911349123491334914349153491634917349183491934920349213492234923349243492534926349273492834929349303493134932349333493434935349363493734938349393494034941349423494334944349453494634947349483494934950349513495234953349543495534956349573495834959349603496134962349633496434965349663496734968349693497034971349723497334974349753497634977349783497934980349813498234983349843498534986349873498834989349903499134992349933499434995349963499734998349993500035001350023500335004350053500635007350083500935010350113501235013350143501535016350173501835019350203502135022350233502435025350263502735028350293503035031350323503335034350353503635037350383503935040350413504235043350443504535046350473504835049350503505135052350533505435055350563505735058350593506035061350623506335064350653506635067350683506935070350713507235073350743507535076350773507835079350803508135082350833508435085350863508735088350893509035091350923509335094350953509635097350983509935100351013510235103351043510535106351073510835109351103511135112351133511435115351163511735118351193512035121351223512335124351253512635127351283512935130351313513235133351343513535136351373513835139351403514135142351433514435145351463514735148351493515035151351523515335154351553515635157351583515935160351613516235163351643516535166351673516835169351703517135172351733517435175351763517735178351793518035181351823518335184351853518635187351883518935190351913519235193351943519535196351973519835199352003520135202352033520435205352063520735208352093521035211352123521335214352153521635217352183521935220352213522235223352243522535226352273522835229352303523135232352333523435235352363523735238352393524035241352423524335244352453524635247352483524935250352513525235253352543525535256352573525835259352603526135262352633526435265352663526735268352693527035271352723527335274352753527635277352783527935280352813528235283352843528535286352873528835289352903529135292352933529435295352963529735298352993530035301353023530335304353053530635307353083530935310353113531235313353143531535316353173531835319353203532135322353233532435325353263532735328353293533035331353323533335334353353533635337353383533935340353413534235343353443534535346353473534835349353503535135352353533535435355353563535735358353593536035361353623536335364353653536635367353683536935370353713537235373353743537535376353773537835379353803538135382353833538435385353863538735388353893539035391353923539335394353953539635397353983539935400354013540235403354043540535406354073540835409354103541135412354133541435415354163541735418354193542035421354223542335424354253542635427354283542935430354313543235433354343543535436354373543835439354403544135442354433544435445354463544735448354493545035451354523545335454354553545635457354583545935460354613546235463354643546535466354673546835469354703547135472354733547435475354763547735478354793548035481354823548335484354853548635487354883548935490354913549235493354943549535496354973549835499355003550135502355033550435505355063550735508355093551035511355123551335514355153551635517355183551935520355213552235523355243552535526355273552835529355303553135532355333553435535355363553735538355393554035541355423554335544355453554635547355483554935550355513555235553355543555535556355573555835559355603556135562355633556435565355663556735568355693557035571355723557335574355753557635577355783557935580355813558235583355843558535586355873558835589355903559135592355933559435595355963559735598355993560035601356023560335604356053560635607356083560935610356113561235613356143561535616356173561835619356203562135622356233562435625356263562735628356293563035631356323563335634356353563635637356383563935640356413564235643356443564535646356473564835649356503565135652356533565435655356563565735658356593566035661356623566335664356653566635667356683566935670356713567235673356743567535676356773567835679356803568135682356833568435685356863568735688356893569035691356923569335694356953569635697356983569935700357013570235703357043570535706357073570835709357103571135712357133571435715357163571735718357193572035721357223572335724357253572635727357283572935730357313573235733357343573535736357373573835739357403574135742357433574435745357463574735748357493575035751357523575335754357553575635757357583575935760357613576235763357643576535766357673576835769357703577135772357733577435775357763577735778357793578035781357823578335784357853578635787357883578935790357913579235793357943579535796357973579835799358003580135802358033580435805358063580735808358093581035811358123581335814358153581635817358183581935820358213582235823358243582535826358273582835829358303583135832358333583435835358363583735838358393584035841358423584335844358453584635847358483584935850358513585235853358543585535856358573585835859358603586135862358633586435865358663586735868358693587035871358723587335874358753587635877358783587935880358813588235883358843588535886358873588835889358903589135892358933589435895358963589735898358993590035901359023590335904359053590635907359083590935910359113591235913359143591535916359173591835919359203592135922359233592435925359263592735928359293593035931359323593335934359353593635937359383593935940359413594235943359443594535946359473594835949359503595135952359533595435955359563595735958359593596035961359623596335964359653596635967359683596935970359713597235973359743597535976359773597835979359803598135982359833598435985359863598735988359893599035991359923599335994359953599635997359983599936000360013600236003360043600536006360073600836009360103601136012360133601436015360163601736018360193602036021360223602336024360253602636027360283602936030360313603236033360343603536036360373603836039360403604136042360433604436045360463604736048360493605036051360523605336054360553605636057360583605936060360613606236063360643606536066360673606836069360703607136072360733607436075360763607736078360793608036081360823608336084360853608636087360883608936090360913609236093360943609536096360973609836099361003610136102361033610436105361063610736108361093611036111361123611336114361153611636117361183611936120361213612236123361243612536126361273612836129361303613136132361333613436135361363613736138361393614036141361423614336144361453614636147361483614936150361513615236153361543615536156361573615836159361603616136162361633616436165361663616736168361693617036171361723617336174361753617636177361783617936180361813618236183361843618536186361873618836189361903619136192361933619436195361963619736198361993620036201362023620336204362053620636207362083620936210362113621236213362143621536216362173621836219362203622136222362233622436225362263622736228362293623036231362323623336234362353623636237362383623936240362413624236243362443624536246362473624836249362503625136252362533625436255362563625736258362593626036261362623626336264362653626636267362683626936270362713627236273362743627536276362773627836279362803628136282362833628436285362863628736288362893629036291362923629336294362953629636297362983629936300363013630236303363043630536306363073630836309363103631136312363133631436315363163631736318363193632036321363223632336324363253632636327363283632936330363313633236333363343633536336363373633836339363403634136342363433634436345363463634736348363493635036351363523635336354363553635636357363583635936360363613636236363363643636536366363673636836369363703637136372363733637436375363763637736378363793638036381363823638336384363853638636387363883638936390363913639236393363943639536396363973639836399364003640136402364033640436405364063640736408364093641036411364123641336414364153641636417364183641936420364213642236423364243642536426364273642836429364303643136432364333643436435364363643736438364393644036441364423644336444364453644636447364483644936450364513645236453364543645536456364573645836459364603646136462364633646436465364663646736468364693647036471364723647336474364753647636477364783647936480364813648236483364843648536486364873648836489364903649136492364933649436495364963649736498364993650036501365023650336504365053650636507365083650936510365113651236513365143651536516365173651836519365203652136522365233652436525365263652736528365293653036531365323653336534365353653636537365383653936540365413654236543365443654536546365473654836549365503655136552365533655436555365563655736558365593656036561365623656336564365653656636567365683656936570365713657236573365743657536576365773657836579365803658136582365833658436585365863658736588365893659036591365923659336594365953659636597365983659936600366013660236603366043660536606366073660836609366103661136612366133661436615366163661736618366193662036621366223662336624366253662636627366283662936630366313663236633366343663536636366373663836639366403664136642366433664436645366463664736648366493665036651366523665336654366553665636657366583665936660366613666236663366643666536666366673666836669366703667136672366733667436675366763667736678366793668036681366823668336684366853668636687366883668936690366913669236693366943669536696366973669836699367003670136702367033670436705367063670736708367093671036711367123671336714367153671636717367183671936720367213672236723367243672536726367273672836729367303673136732367333673436735367363673736738367393674036741367423674336744367453674636747367483674936750367513675236753367543675536756367573675836759367603676136762367633676436765367663676736768367693677036771367723677336774367753677636777367783677936780367813678236783367843678536786367873678836789367903679136792367933679436795367963679736798367993680036801368023680336804368053680636807368083680936810368113681236813368143681536816368173681836819368203682136822368233682436825368263682736828368293683036831368323683336834368353683636837368383683936840368413684236843368443684536846368473684836849368503685136852368533685436855368563685736858368593686036861368623686336864368653686636867368683686936870368713687236873368743687536876368773687836879368803688136882368833688436885368863688736888368893689036891368923689336894368953689636897368983689936900369013690236903369043690536906369073690836909369103691136912369133691436915369163691736918369193692036921369223692336924369253692636927369283692936930369313693236933369343693536936369373693836939369403694136942369433694436945369463694736948369493695036951369523695336954369553695636957369583695936960369613696236963369643696536966369673696836969369703697136972369733697436975369763697736978369793698036981369823698336984369853698636987369883698936990369913699236993369943699536996369973699836999370003700137002370033700437005370063700737008370093701037011370123701337014370153701637017370183701937020370213702237023370243702537026370273702837029370303703137032370333703437035370363703737038370393704037041370423704337044370453704637047370483704937050370513705237053370543705537056370573705837059370603706137062370633706437065370663706737068370693707037071370723707337074370753707637077370783707937080370813708237083370843708537086370873708837089370903709137092370933709437095370963709737098370993710037101371023710337104371053710637107371083710937110371113711237113371143711537116371173711837119371203712137122371233712437125371263712737128371293713037131371323713337134371353713637137371383713937140371413714237143371443714537146371473714837149371503715137152371533715437155371563715737158371593716037161371623716337164371653716637167371683716937170371713717237173371743717537176371773717837179371803718137182371833718437185371863718737188371893719037191371923719337194371953719637197371983719937200372013720237203372043720537206372073720837209372103721137212372133721437215372163721737218372193722037221372223722337224372253722637227372283722937230372313723237233372343723537236372373723837239372403724137242372433724437245372463724737248372493725037251372523725337254372553725637257372583725937260372613726237263372643726537266372673726837269372703727137272372733727437275372763727737278372793728037281372823728337284372853728637287372883728937290372913729237293372943729537296372973729837299373003730137302373033730437305373063730737308373093731037311373123731337314373153731637317373183731937320373213732237323373243732537326373273732837329373303733137332373333733437335373363733737338373393734037341373423734337344373453734637347373483734937350373513735237353373543735537356373573735837359373603736137362373633736437365373663736737368373693737037371373723737337374373753737637377373783737937380373813738237383373843738537386373873738837389373903739137392373933739437395373963739737398373993740037401374023740337404374053740637407374083740937410374113741237413374143741537416374173741837419374203742137422374233742437425374263742737428374293743037431374323743337434374353743637437374383743937440374413744237443374443744537446374473744837449374503745137452374533745437455374563745737458374593746037461374623746337464374653746637467374683746937470374713747237473374743747537476374773747837479374803748137482374833748437485374863748737488374893749037491374923749337494374953749637497374983749937500375013750237503375043750537506375073750837509375103751137512375133751437515375163751737518375193752037521375223752337524375253752637527375283752937530375313753237533375343753537536375373753837539375403754137542375433754437545375463754737548375493755037551375523755337554375553755637557375583755937560375613756237563375643756537566375673756837569375703757137572375733757437575375763757737578375793758037581375823758337584375853758637587375883758937590375913759237593375943759537596375973759837599376003760137602376033760437605376063760737608376093761037611376123761337614376153761637617376183761937620376213762237623376243762537626376273762837629376303763137632376333763437635376363763737638376393764037641376423764337644376453764637647376483764937650376513765237653376543765537656376573765837659376603766137662376633766437665376663766737668376693767037671376723767337674376753767637677376783767937680376813768237683376843768537686376873768837689376903769137692376933769437695376963769737698376993770037701377023770337704377053770637707377083770937710377113771237713377143771537716377173771837719377203772137722377233772437725377263772737728377293773037731377323773337734377353773637737377383773937740377413774237743377443774537746377473774837749377503775137752377533775437755377563775737758377593776037761377623776337764377653776637767377683776937770377713777237773377743777537776377773777837779377803778137782377833778437785377863778737788377893779037791377923779337794377953779637797377983779937800378013780237803378043780537806378073780837809378103781137812378133781437815378163781737818378193782037821378223782337824378253782637827378283782937830378313783237833378343783537836378373783837839378403784137842378433784437845378463784737848378493785037851378523785337854378553785637857378583785937860378613786237863378643786537866378673786837869378703787137872378733787437875378763787737878378793788037881378823788337884378853788637887378883788937890378913789237893378943789537896378973789837899379003790137902379033790437905379063790737908379093791037911379123791337914379153791637917379183791937920379213792237923379243792537926379273792837929379303793137932379333793437935379363793737938379393794037941379423794337944379453794637947379483794937950379513795237953379543795537956379573795837959379603796137962379633796437965379663796737968379693797037971379723797337974379753797637977379783797937980379813798237983379843798537986379873798837989379903799137992379933799437995379963799737998379993800038001380023800338004380053800638007380083800938010380113801238013380143801538016380173801838019380203802138022380233802438025380263802738028380293803038031380323803338034380353803638037380383803938040380413804238043380443804538046380473804838049380503805138052380533805438055380563805738058380593806038061380623806338064380653806638067380683806938070380713807238073380743807538076380773807838079380803808138082380833808438085380863808738088380893809038091380923809338094380953809638097380983809938100381013810238103381043810538106381073810838109381103811138112381133811438115381163811738118381193812038121381223812338124381253812638127381283812938130381313813238133381343813538136381373813838139381403814138142381433814438145381463814738148381493815038151381523815338154381553815638157381583815938160381613816238163381643816538166381673816838169381703817138172381733817438175381763817738178381793818038181381823818338184381853818638187381883818938190381913819238193381943819538196381973819838199382003820138202382033820438205382063820738208382093821038211382123821338214382153821638217382183821938220382213822238223382243822538226382273822838229382303823138232382333823438235382363823738238382393824038241382423824338244382453824638247382483824938250382513825238253382543825538256382573825838259382603826138262382633826438265382663826738268382693827038271382723827338274382753827638277382783827938280382813828238283382843828538286382873828838289382903829138292382933829438295382963829738298382993830038301383023830338304383053830638307383083830938310383113831238313383143831538316383173831838319383203832138322383233832438325383263832738328383293833038331383323833338334383353833638337383383833938340383413834238343383443834538346383473834838349383503835138352383533835438355383563835738358383593836038361383623836338364383653836638367383683836938370383713837238373383743837538376383773837838379383803838138382383833838438385383863838738388383893839038391383923839338394383953839638397383983839938400384013840238403384043840538406384073840838409384103841138412384133841438415384163841738418384193842038421384223842338424384253842638427384283842938430384313843238433384343843538436384373843838439384403844138442384433844438445384463844738448384493845038451384523845338454384553845638457384583845938460384613846238463384643846538466384673846838469384703847138472384733847438475384763847738478384793848038481384823848338484384853848638487384883848938490384913849238493384943849538496384973849838499385003850138502385033850438505385063850738508385093851038511385123851338514385153851638517385183851938520385213852238523385243852538526385273852838529385303853138532385333853438535385363853738538385393854038541385423854338544385453854638547385483854938550385513855238553385543855538556385573855838559385603856138562385633856438565385663856738568385693857038571385723857338574385753857638577385783857938580385813858238583385843858538586385873858838589385903859138592385933859438595385963859738598385993860038601386023860338604386053860638607386083860938610386113861238613386143861538616386173861838619386203862138622386233862438625386263862738628386293863038631386323863338634386353863638637386383863938640386413864238643386443864538646386473864838649386503865138652386533865438655386563865738658386593866038661386623866338664386653866638667386683866938670386713867238673386743867538676386773867838679386803868138682386833868438685386863868738688386893869038691386923869338694386953869638697386983869938700387013870238703387043870538706387073870838709387103871138712387133871438715387163871738718387193872038721387223872338724387253872638727387283872938730387313873238733387343873538736387373873838739387403874138742387433874438745387463874738748387493875038751387523875338754387553875638757387583875938760387613876238763387643876538766387673876838769387703877138772387733877438775387763877738778387793878038781387823878338784387853878638787387883878938790387913879238793387943879538796387973879838799388003880138802388033880438805388063880738808388093881038811388123881338814388153881638817388183881938820388213882238823388243882538826388273882838829388303883138832388333883438835388363883738838388393884038841388423884338844388453884638847388483884938850388513885238853388543885538856388573885838859388603886138862388633886438865388663886738868388693887038871388723887338874388753887638877388783887938880388813888238883388843888538886388873888838889388903889138892388933889438895388963889738898388993890038901389023890338904389053890638907389083890938910389113891238913389143891538916389173891838919389203892138922389233892438925389263892738928389293893038931389323893338934389353893638937389383893938940389413894238943389443894538946389473894838949389503895138952389533895438955389563895738958389593896038961389623896338964389653896638967389683896938970389713897238973389743897538976389773897838979389803898138982389833898438985389863898738988389893899038991389923899338994389953899638997389983899939000390013900239003390043900539006390073900839009390103901139012390133901439015390163901739018390193902039021390223902339024390253902639027390283902939030390313903239033390343903539036390373903839039390403904139042390433904439045390463904739048390493905039051390523905339054390553905639057390583905939060390613906239063390643906539066390673906839069390703907139072390733907439075390763907739078390793908039081390823908339084390853908639087390883908939090390913909239093390943909539096390973909839099391003910139102391033910439105391063910739108391093911039111391123911339114391153911639117391183911939120391213912239123391243912539126391273912839129391303913139132391333913439135391363913739138391393914039141391423914339144391453914639147391483914939150391513915239153391543915539156391573915839159391603916139162391633916439165391663916739168391693917039171391723917339174391753917639177391783917939180391813918239183391843918539186391873918839189391903919139192391933919439195391963919739198391993920039201392023920339204392053920639207392083920939210392113921239213392143921539216392173921839219392203922139222392233922439225392263922739228392293923039231392323923339234392353923639237392383923939240392413924239243392443924539246392473924839249392503925139252392533925439255392563925739258392593926039261392623926339264392653926639267392683926939270392713927239273392743927539276392773927839279392803928139282392833928439285392863928739288392893929039291392923929339294392953929639297392983929939300393013930239303393043930539306393073930839309393103931139312393133931439315393163931739318393193932039321393223932339324393253932639327393283932939330393313933239333393343933539336393373933839339393403934139342393433934439345393463934739348393493935039351393523935339354393553935639357393583935939360393613936239363393643936539366393673936839369393703937139372393733937439375393763937739378393793938039381393823938339384393853938639387393883938939390393913939239393393943939539396393973939839399394003940139402394033940439405394063940739408394093941039411394123941339414394153941639417394183941939420394213942239423394243942539426394273942839429394303943139432394333943439435394363943739438394393944039441394423944339444394453944639447394483944939450394513945239453394543945539456394573945839459394603946139462394633946439465394663946739468394693947039471394723947339474394753947639477394783947939480394813948239483394843948539486394873948839489394903949139492394933949439495394963949739498394993950039501395023950339504395053950639507395083950939510395113951239513395143951539516395173951839519395203952139522395233952439525395263952739528395293953039531395323953339534395353953639537395383953939540395413954239543395443954539546395473954839549395503955139552395533955439555395563955739558395593956039561395623956339564395653956639567395683956939570395713957239573395743957539576395773957839579395803958139582395833958439585395863958739588395893959039591395923959339594395953959639597395983959939600396013960239603396043960539606396073960839609396103961139612396133961439615396163961739618396193962039621396223962339624396253962639627396283962939630396313963239633396343963539636396373963839639396403964139642396433964439645396463964739648396493965039651396523965339654396553965639657396583965939660396613966239663396643966539666396673966839669396703967139672396733967439675396763967739678396793968039681396823968339684396853968639687396883968939690396913969239693396943969539696396973969839699397003970139702397033970439705397063970739708397093971039711397123971339714397153971639717397183971939720397213972239723397243972539726397273972839729397303973139732397333973439735397363973739738397393974039741397423974339744397453974639747397483974939750397513975239753397543975539756397573975839759397603976139762397633976439765397663976739768397693977039771397723977339774397753977639777397783977939780397813978239783397843978539786397873978839789397903979139792397933979439795397963979739798397993980039801398023980339804398053980639807398083980939810398113981239813398143981539816398173981839819398203982139822398233982439825398263982739828398293983039831398323983339834398353983639837398383983939840398413984239843398443984539846398473984839849398503985139852398533985439855398563985739858398593986039861398623986339864398653986639867398683986939870398713987239873398743987539876398773987839879398803988139882398833988439885398863988739888398893989039891398923989339894398953989639897398983989939900399013990239903399043990539906399073990839909399103991139912399133991439915399163991739918399193992039921399223992339924399253992639927399283992939930399313993239933399343993539936399373993839939399403994139942399433994439945399463994739948399493995039951399523995339954399553995639957399583995939960399613996239963399643996539966399673996839969399703997139972399733997439975399763997739978399793998039981399823998339984399853998639987399883998939990399913999239993399943999539996399973999839999400004000140002400034000440005400064000740008400094001040011400124001340014400154001640017400184001940020400214002240023400244002540026400274002840029400304003140032400334003440035400364003740038400394004040041400424004340044400454004640047400484004940050400514005240053400544005540056400574005840059400604006140062400634006440065400664006740068400694007040071400724007340074400754007640077400784007940080400814008240083400844008540086400874008840089400904009140092400934009440095400964009740098400994010040101401024010340104401054010640107401084010940110401114011240113401144011540116401174011840119401204012140122401234012440125401264012740128401294013040131401324013340134401354013640137401384013940140401414014240143401444014540146401474014840149401504015140152401534015440155401564015740158401594016040161401624016340164401654016640167401684016940170401714017240173401744017540176401774017840179401804018140182401834018440185401864018740188401894019040191401924019340194401954019640197401984019940200402014020240203402044020540206402074020840209402104021140212402134021440215402164021740218402194022040221402224022340224402254022640227402284022940230402314023240233402344023540236402374023840239402404024140242402434024440245402464024740248402494025040251402524025340254402554025640257402584025940260402614026240263402644026540266402674026840269402704027140272402734027440275402764027740278402794028040281402824028340284402854028640287402884028940290402914029240293402944029540296402974029840299403004030140302403034030440305403064030740308403094031040311403124031340314403154031640317403184031940320403214032240323403244032540326403274032840329403304033140332403334033440335403364033740338403394034040341403424034340344403454034640347403484034940350403514035240353403544035540356403574035840359403604036140362403634036440365403664036740368403694037040371403724037340374403754037640377403784037940380403814038240383403844038540386403874038840389403904039140392403934039440395403964039740398403994040040401404024040340404404054040640407404084040940410404114041240413404144041540416404174041840419404204042140422404234042440425404264042740428404294043040431404324043340434404354043640437404384043940440404414044240443404444044540446404474044840449404504045140452404534045440455404564045740458404594046040461404624046340464404654046640467404684046940470404714047240473404744047540476404774047840479404804048140482404834048440485404864048740488404894049040491404924049340494404954049640497404984049940500405014050240503405044050540506405074050840509405104051140512405134051440515405164051740518405194052040521405224052340524405254052640527405284052940530405314053240533405344053540536405374053840539405404054140542405434054440545405464054740548405494055040551405524055340554405554055640557405584055940560405614056240563405644056540566405674056840569405704057140572405734057440575405764057740578405794058040581405824058340584405854058640587405884058940590405914059240593405944059540596405974059840599406004060140602406034060440605406064060740608406094061040611406124061340614406154061640617406184061940620406214062240623406244062540626406274062840629406304063140632406334063440635406364063740638406394064040641406424064340644406454064640647406484064940650406514065240653406544065540656406574065840659406604066140662406634066440665406664066740668406694067040671406724067340674406754067640677406784067940680406814068240683406844068540686406874068840689406904069140692406934069440695406964069740698406994070040701407024070340704407054070640707407084070940710407114071240713407144071540716407174071840719407204072140722407234072440725407264072740728407294073040731407324073340734407354073640737407384073940740407414074240743407444074540746407474074840749407504075140752407534075440755407564075740758407594076040761407624076340764407654076640767407684076940770407714077240773407744077540776407774077840779407804078140782407834078440785407864078740788407894079040791407924079340794407954079640797407984079940800408014080240803408044080540806408074080840809408104081140812408134081440815408164081740818408194082040821408224082340824408254082640827408284082940830408314083240833408344083540836408374083840839408404084140842408434084440845408464084740848408494085040851408524085340854408554085640857408584085940860408614086240863408644086540866408674086840869408704087140872408734087440875408764087740878408794088040881408824088340884408854088640887408884088940890408914089240893408944089540896408974089840899409004090140902409034090440905409064090740908409094091040911409124091340914409154091640917409184091940920409214092240923409244092540926409274092840929409304093140932409334093440935409364093740938409394094040941409424094340944409454094640947409484094940950409514095240953409544095540956409574095840959409604096140962409634096440965409664096740968409694097040971409724097340974409754097640977409784097940980409814098240983409844098540986409874098840989409904099140992409934099440995409964099740998409994100041001410024100341004410054100641007410084100941010410114101241013410144101541016410174101841019410204102141022410234102441025410264102741028410294103041031410324103341034410354103641037410384103941040410414104241043410444104541046410474104841049410504105141052410534105441055410564105741058410594106041061410624106341064410654106641067410684106941070410714107241073410744107541076410774107841079410804108141082410834108441085410864108741088410894109041091410924109341094410954109641097410984109941100411014110241103411044110541106411074110841109411104111141112411134111441115411164111741118411194112041121411224112341124411254112641127411284112941130411314113241133411344113541136411374113841139411404114141142411434114441145411464114741148411494115041151411524115341154411554115641157411584115941160411614116241163411644116541166411674116841169411704117141172411734117441175411764117741178411794118041181411824118341184411854118641187411884118941190411914119241193411944119541196411974119841199412004120141202412034120441205412064120741208412094121041211412124121341214412154121641217412184121941220412214122241223412244122541226412274122841229412304123141232412334123441235412364123741238412394124041241412424124341244412454124641247412484124941250412514125241253412544125541256412574125841259412604126141262412634126441265412664126741268412694127041271412724127341274412754127641277412784127941280412814128241283412844128541286412874128841289412904129141292412934129441295412964129741298412994130041301413024130341304413054130641307413084130941310413114131241313413144131541316413174131841319413204132141322413234132441325413264132741328413294133041331413324133341334413354133641337413384133941340413414134241343413444134541346413474134841349413504135141352413534135441355413564135741358413594136041361413624136341364413654136641367413684136941370413714137241373413744137541376413774137841379413804138141382413834138441385413864138741388413894139041391413924139341394413954139641397413984139941400414014140241403414044140541406414074140841409414104141141412414134141441415414164141741418414194142041421414224142341424414254142641427414284142941430414314143241433414344143541436414374143841439414404144141442414434144441445414464144741448414494145041451414524145341454414554145641457414584145941460414614146241463414644146541466414674146841469414704147141472414734147441475414764147741478414794148041481414824148341484414854148641487414884148941490414914149241493414944149541496414974149841499415004150141502415034150441505415064150741508415094151041511415124151341514415154151641517415184151941520415214152241523415244152541526415274152841529415304153141532415334153441535415364153741538415394154041541415424154341544415454154641547415484154941550415514155241553415544155541556415574155841559415604156141562415634156441565415664156741568415694157041571415724157341574415754157641577415784157941580415814158241583415844158541586415874158841589415904159141592415934159441595415964159741598415994160041601416024160341604416054160641607416084160941610416114161241613416144161541616416174161841619416204162141622416234162441625416264162741628416294163041631416324163341634416354163641637416384163941640416414164241643416444164541646416474164841649416504165141652416534165441655416564165741658416594166041661416624166341664416654166641667416684166941670416714167241673416744167541676416774167841679416804168141682416834168441685416864168741688416894169041691416924169341694416954169641697416984169941700417014170241703417044170541706417074170841709417104171141712417134171441715417164171741718417194172041721417224172341724417254172641727417284172941730417314173241733417344173541736417374173841739417404174141742417434174441745417464174741748417494175041751417524175341754417554175641757417584175941760417614176241763417644176541766417674176841769417704177141772417734177441775417764177741778417794178041781417824178341784417854178641787417884178941790417914179241793417944179541796417974179841799418004180141802418034180441805418064180741808418094181041811418124181341814418154181641817418184181941820418214182241823418244182541826418274182841829418304183141832418334183441835418364183741838418394184041841418424184341844418454184641847418484184941850418514185241853418544185541856418574185841859418604186141862418634186441865418664186741868418694187041871418724187341874418754187641877418784187941880418814188241883418844188541886418874188841889418904189141892418934189441895418964189741898418994190041901419024190341904419054190641907419084190941910419114191241913419144191541916419174191841919419204192141922419234192441925419264192741928419294193041931419324193341934419354193641937419384193941940419414194241943419444194541946419474194841949419504195141952419534195441955419564195741958419594196041961419624196341964419654196641967419684196941970419714197241973419744197541976419774197841979419804198141982419834198441985419864198741988419894199041991419924199341994419954199641997419984199942000420014200242003420044200542006420074200842009420104201142012420134201442015420164201742018420194202042021420224202342024420254202642027420284202942030420314203242033420344203542036420374203842039420404204142042420434204442045420464204742048420494205042051420524205342054420554205642057420584205942060420614206242063420644206542066420674206842069420704207142072420734207442075420764207742078420794208042081420824208342084420854208642087420884208942090420914209242093420944209542096420974209842099421004210142102421034210442105421064210742108421094211042111421124211342114421154211642117421184211942120421214212242123421244212542126421274212842129421304213142132421334213442135421364213742138421394214042141421424214342144421454214642147421484214942150421514215242153421544215542156421574215842159421604216142162421634216442165421664216742168421694217042171421724217342174421754217642177421784217942180421814218242183421844218542186421874218842189421904219142192421934219442195421964219742198421994220042201422024220342204422054220642207422084220942210422114221242213422144221542216422174221842219422204222142222422234222442225422264222742228422294223042231422324223342234422354223642237422384223942240422414224242243422444224542246422474224842249422504225142252422534225442255422564225742258422594226042261422624226342264422654226642267422684226942270422714227242273422744227542276422774227842279422804228142282422834228442285422864228742288422894229042291422924229342294422954229642297422984229942300423014230242303423044230542306423074230842309423104231142312423134231442315423164231742318423194232042321423224232342324423254232642327423284232942330423314233242333423344233542336423374233842339423404234142342423434234442345423464234742348423494235042351423524235342354423554235642357423584235942360423614236242363423644236542366423674236842369423704237142372423734237442375423764237742378423794238042381423824238342384423854238642387423884238942390423914239242393423944239542396423974239842399424004240142402424034240442405424064240742408424094241042411424124241342414424154241642417424184241942420424214242242423424244242542426424274242842429424304243142432424334243442435424364243742438424394244042441424424244342444424454244642447424484244942450424514245242453424544245542456424574245842459424604246142462424634246442465424664246742468424694247042471424724247342474424754247642477424784247942480424814248242483424844248542486424874248842489424904249142492424934249442495424964249742498424994250042501425024250342504425054250642507425084250942510425114251242513425144251542516425174251842519425204252142522425234252442525425264252742528425294253042531425324253342534425354253642537425384253942540425414254242543425444254542546425474254842549425504255142552425534255442555425564255742558425594256042561425624256342564425654256642567425684256942570425714257242573425744257542576425774257842579425804258142582425834258442585425864258742588425894259042591425924259342594425954259642597425984259942600426014260242603426044260542606426074260842609426104261142612426134261442615426164261742618426194262042621426224262342624426254262642627426284262942630426314263242633426344263542636426374263842639426404264142642426434264442645426464264742648426494265042651426524265342654426554265642657426584265942660426614266242663426644266542666426674266842669426704267142672426734267442675426764267742678426794268042681426824268342684426854268642687426884268942690426914269242693426944269542696426974269842699427004270142702427034270442705427064270742708427094271042711427124271342714427154271642717427184271942720427214272242723427244272542726427274272842729427304273142732427334273442735427364273742738427394274042741427424274342744427454274642747427484274942750427514275242753427544275542756427574275842759427604276142762427634276442765427664276742768427694277042771427724277342774427754277642777427784277942780427814278242783427844278542786427874278842789427904279142792427934279442795427964279742798427994280042801428024280342804428054280642807428084280942810428114281242813428144281542816428174281842819428204282142822428234282442825428264282742828428294283042831428324283342834428354283642837428384283942840428414284242843428444284542846428474284842849428504285142852428534285442855428564285742858428594286042861428624286342864428654286642867428684286942870428714287242873428744287542876428774287842879428804288142882428834288442885428864288742888428894289042891428924289342894428954289642897428984289942900429014290242903429044290542906429074290842909429104291142912429134291442915429164291742918429194292042921429224292342924429254292642927429284292942930429314293242933429344293542936429374293842939429404294142942429434294442945429464294742948429494295042951429524295342954429554295642957429584295942960429614296242963429644296542966429674296842969429704297142972429734297442975429764297742978429794298042981429824298342984429854298642987429884298942990429914299242993429944299542996429974299842999430004300143002430034300443005430064300743008430094301043011430124301343014430154301643017430184301943020430214302243023430244302543026430274302843029430304303143032430334303443035430364303743038430394304043041430424304343044430454304643047430484304943050430514305243053430544305543056430574305843059430604306143062430634306443065430664306743068430694307043071430724307343074430754307643077430784307943080430814308243083430844308543086430874308843089430904309143092430934309443095430964309743098430994310043101431024310343104431054310643107431084310943110431114311243113431144311543116431174311843119431204312143122431234312443125431264312743128431294313043131431324313343134431354313643137431384313943140431414314243143431444314543146431474314843149431504315143152431534315443155431564315743158431594316043161431624316343164431654316643167431684316943170431714317243173431744317543176431774317843179431804318143182431834318443185431864318743188431894319043191431924319343194431954319643197431984319943200432014320243203432044320543206432074320843209432104321143212432134321443215432164321743218432194322043221432224322343224432254322643227432284322943230432314323243233432344323543236432374323843239432404324143242432434324443245432464324743248432494325043251432524325343254432554325643257432584325943260432614326243263432644326543266432674326843269432704327143272432734327443275432764327743278432794328043281432824328343284432854328643287432884328943290432914329243293432944329543296432974329843299433004330143302433034330443305433064330743308433094331043311433124331343314433154331643317433184331943320433214332243323433244332543326433274332843329433304333143332433334333443335433364333743338433394334043341433424334343344433454334643347433484334943350433514335243353433544335543356433574335843359433604336143362433634336443365433664336743368433694337043371433724337343374433754337643377433784337943380433814338243383433844338543386433874338843389433904339143392433934339443395433964339743398433994340043401434024340343404434054340643407434084340943410434114341243413434144341543416434174341843419434204342143422434234342443425434264342743428434294343043431434324343343434434354343643437434384343943440434414344243443434444344543446434474344843449434504345143452434534345443455434564345743458434594346043461434624346343464434654346643467434684346943470434714347243473434744347543476434774347843479434804348143482434834348443485434864348743488434894349043491434924349343494434954349643497434984349943500435014350243503435044350543506435074350843509435104351143512435134351443515435164351743518435194352043521435224352343524435254352643527435284352943530435314353243533435344353543536435374353843539435404354143542435434354443545435464354743548435494355043551435524355343554435554355643557435584355943560435614356243563435644356543566435674356843569435704357143572435734357443575435764357743578435794358043581435824358343584435854358643587435884358943590435914359243593435944359543596435974359843599436004360143602436034360443605436064360743608436094361043611436124361343614436154361643617436184361943620436214362243623436244362543626436274362843629436304363143632436334363443635436364363743638436394364043641436424364343644436454364643647436484364943650436514365243653436544365543656436574365843659436604366143662436634366443665436664366743668436694367043671436724367343674436754367643677436784367943680436814368243683436844368543686436874368843689436904369143692436934369443695436964369743698436994370043701437024370343704437054370643707437084370943710437114371243713437144371543716437174371843719437204372143722437234372443725437264372743728437294373043731437324373343734437354373643737437384373943740437414374243743437444374543746437474374843749437504375143752437534375443755437564375743758437594376043761437624376343764437654376643767437684376943770437714377243773437744377543776437774377843779437804378143782437834378443785437864378743788437894379043791437924379343794437954379643797437984379943800438014380243803438044380543806438074380843809438104381143812438134381443815438164381743818438194382043821438224382343824438254382643827438284382943830438314383243833438344383543836438374383843839438404384143842438434384443845438464384743848438494385043851438524385343854438554385643857438584385943860438614386243863438644386543866438674386843869438704387143872438734387443875438764387743878438794388043881438824388343884438854388643887438884388943890438914389243893438944389543896438974389843899439004390143902439034390443905439064390743908439094391043911439124391343914439154391643917439184391943920439214392243923439244392543926439274392843929439304393143932439334393443935439364393743938439394394043941439424394343944439454394643947439484394943950439514395243953439544395543956439574395843959439604396143962439634396443965439664396743968439694397043971439724397343974439754397643977439784397943980439814398243983439844398543986439874398843989439904399143992439934399443995439964399743998439994400044001440024400344004440054400644007440084400944010440114401244013440144401544016440174401844019440204402144022440234402444025440264402744028440294403044031440324403344034440354403644037440384403944040440414404244043440444404544046440474404844049440504405144052440534405444055440564405744058440594406044061440624406344064440654406644067440684406944070440714407244073440744407544076440774407844079440804408144082440834408444085440864408744088440894409044091440924409344094440954409644097440984409944100441014410244103441044410544106441074410844109441104411144112441134411444115441164411744118441194412044121441224412344124441254412644127441284412944130441314413244133441344413544136441374413844139441404414144142441434414444145441464414744148441494415044151441524415344154441554415644157441584415944160441614416244163441644416544166441674416844169441704417144172441734417444175441764417744178441794418044181441824418344184441854418644187441884418944190441914419244193441944419544196441974419844199442004420144202442034420444205442064420744208442094421044211442124421344214442154421644217442184421944220442214422244223442244422544226442274422844229442304423144232442334423444235442364423744238442394424044241442424424344244442454424644247442484424944250442514425244253442544425544256442574425844259442604426144262442634426444265442664426744268442694427044271442724427344274442754427644277442784427944280442814428244283442844428544286442874428844289442904429144292442934429444295442964429744298442994430044301443024430344304443054430644307443084430944310443114431244313443144431544316443174431844319443204432144322443234432444325443264432744328443294433044331443324433344334443354433644337443384433944340443414434244343443444434544346443474434844349443504435144352443534435444355443564435744358443594436044361443624436344364443654436644367443684436944370443714437244373443744437544376443774437844379443804438144382443834438444385443864438744388443894439044391443924439344394443954439644397443984439944400444014440244403444044440544406444074440844409444104441144412444134441444415444164441744418444194442044421444224442344424444254442644427444284442944430444314443244433444344443544436444374443844439444404444144442444434444444445444464444744448444494445044451444524445344454444554445644457444584445944460444614446244463444644446544466444674446844469444704447144472444734447444475444764447744478444794448044481444824448344484444854448644487444884448944490444914449244493444944449544496444974449844499445004450144502445034450444505445064450744508445094451044511445124451344514445154451644517445184451944520445214452244523445244452544526445274452844529445304453144532445334453444535445364453744538445394454044541445424454344544445454454644547445484454944550445514455244553445544455544556445574455844559445604456144562445634456444565445664456744568445694457044571445724457344574445754457644577445784457944580445814458244583445844458544586445874458844589445904459144592445934459444595445964459744598445994460044601446024460344604446054460644607446084460944610446114461244613446144461544616446174461844619446204462144622446234462444625446264462744628446294463044631446324463344634446354463644637446384463944640446414464244643446444464544646446474464844649446504465144652446534465444655446564465744658446594466044661446624466344664446654466644667446684466944670446714467244673446744467544676446774467844679446804468144682446834468444685446864468744688446894469044691446924469344694446954469644697446984469944700447014470244703447044470544706447074470844709447104471144712447134471444715447164471744718447194472044721447224472344724447254472644727447284472944730447314473244733447344473544736447374473844739447404474144742447434474444745447464474744748447494475044751447524475344754447554475644757447584475944760447614476244763447644476544766447674476844769447704477144772447734477444775447764477744778447794478044781447824478344784447854478644787447884478944790447914479244793447944479544796447974479844799448004480144802448034480444805448064480744808448094481044811448124481344814448154481644817448184481944820448214482244823448244482544826448274482844829448304483144832448334483444835448364483744838448394484044841448424484344844448454484644847448484484944850448514485244853448544485544856448574485844859448604486144862448634486444865448664486744868448694487044871448724487344874448754487644877448784487944880448814488244883448844488544886448874488844889448904489144892448934489444895448964489744898448994490044901449024490344904449054490644907449084490944910449114491244913449144491544916449174491844919449204492144922449234492444925449264492744928449294493044931449324493344934449354493644937449384493944940449414494244943449444494544946449474494844949449504495144952449534495444955449564495744958449594496044961449624496344964449654496644967449684496944970449714497244973449744497544976449774497844979449804498144982449834498444985449864498744988449894499044991449924499344994449954499644997449984499945000450014500245003450044500545006450074500845009450104501145012450134501445015450164501745018450194502045021450224502345024450254502645027450284502945030450314503245033450344503545036450374503845039450404504145042450434504445045450464504745048450494505045051450524505345054450554505645057450584505945060450614506245063450644506545066450674506845069450704507145072450734507445075450764507745078450794508045081450824508345084450854508645087450884508945090450914509245093450944509545096450974509845099451004510145102451034510445105451064510745108451094511045111451124511345114451154511645117451184511945120451214512245123451244512545126451274512845129451304513145132451334513445135451364513745138451394514045141451424514345144451454514645147451484514945150451514515245153451544515545156451574515845159451604516145162451634516445165451664516745168451694517045171451724517345174451754517645177451784517945180451814518245183451844518545186451874518845189451904519145192451934519445195451964519745198451994520045201452024520345204452054520645207452084520945210452114521245213452144521545216452174521845219452204522145222452234522445225452264522745228452294523045231452324523345234452354523645237452384523945240452414524245243452444524545246452474524845249452504525145252452534525445255452564525745258452594526045261452624526345264452654526645267452684526945270452714527245273452744527545276452774527845279452804528145282452834528445285452864528745288452894529045291452924529345294452954529645297452984529945300453014530245303453044530545306453074530845309453104531145312453134531445315453164531745318453194532045321453224532345324453254532645327453284532945330453314533245333453344533545336453374533845339453404534145342453434534445345453464534745348453494535045351453524535345354453554535645357453584535945360453614536245363453644536545366453674536845369453704537145372453734537445375453764537745378453794538045381453824538345384453854538645387453884538945390453914539245393453944539545396453974539845399454004540145402454034540445405454064540745408454094541045411454124541345414454154541645417454184541945420454214542245423454244542545426454274542845429454304543145432454334543445435454364543745438454394544045441454424544345444454454544645447454484544945450454514545245453454544545545456454574545845459454604546145462454634546445465454664546745468454694547045471454724547345474454754547645477454784547945480454814548245483454844548545486454874548845489454904549145492454934549445495454964549745498454994550045501455024550345504455054550645507455084550945510455114551245513455144551545516455174551845519455204552145522455234552445525455264552745528455294553045531455324553345534455354553645537455384553945540455414554245543455444554545546455474554845549455504555145552455534555445555455564555745558455594556045561455624556345564455654556645567455684556945570455714557245573455744557545576455774557845579455804558145582455834558445585455864558745588455894559045591455924559345594455954559645597455984559945600456014560245603456044560545606456074560845609456104561145612456134561445615456164561745618456194562045621456224562345624456254562645627456284562945630456314563245633456344563545636456374563845639456404564145642456434564445645456464564745648456494565045651456524565345654456554565645657456584565945660456614566245663456644566545666456674566845669456704567145672456734567445675456764567745678456794568045681456824568345684456854568645687456884568945690456914569245693456944569545696456974569845699457004570145702457034570445705457064570745708457094571045711457124571345714457154571645717457184571945720457214572245723457244572545726457274572845729457304573145732457334573445735457364573745738457394574045741457424574345744457454574645747457484574945750457514575245753457544575545756457574575845759457604576145762457634576445765457664576745768457694577045771457724577345774457754577645777457784577945780457814578245783457844578545786457874578845789457904579145792457934579445795457964579745798457994580045801458024580345804458054580645807458084580945810458114581245813458144581545816458174581845819458204582145822458234582445825458264582745828458294583045831458324583345834458354583645837458384583945840458414584245843458444584545846458474584845849458504585145852458534585445855458564585745858458594586045861458624586345864458654586645867458684586945870458714587245873458744587545876458774587845879458804588145882458834588445885458864588745888458894589045891458924589345894458954589645897458984589945900459014590245903459044590545906459074590845909459104591145912459134591445915459164591745918459194592045921459224592345924459254592645927459284592945930459314593245933459344593545936459374593845939459404594145942459434594445945459464594745948459494595045951459524595345954459554595645957459584595945960459614596245963459644596545966459674596845969459704597145972459734597445975459764597745978459794598045981459824598345984459854598645987459884598945990459914599245993459944599545996459974599845999460004600146002460034600446005460064600746008460094601046011460124601346014460154601646017460184601946020460214602246023460244602546026460274602846029460304603146032460334603446035460364603746038460394604046041460424604346044460454604646047460484604946050460514605246053460544605546056460574605846059460604606146062460634606446065460664606746068460694607046071460724607346074460754607646077460784607946080460814608246083460844608546086460874608846089460904609146092460934609446095460964609746098460994610046101461024610346104461054610646107461084610946110461114611246113461144611546116461174611846119461204612146122461234612446125461264612746128461294613046131461324613346134461354613646137461384613946140461414614246143461444614546146461474614846149461504615146152461534615446155461564615746158461594616046161461624616346164461654616646167461684616946170461714617246173461744617546176461774617846179461804618146182461834618446185461864618746188461894619046191461924619346194461954619646197461984619946200462014620246203462044620546206462074620846209462104621146212462134621446215462164621746218462194622046221462224622346224462254622646227462284622946230462314623246233462344623546236462374623846239462404624146242462434624446245462464624746248462494625046251462524625346254462554625646257462584625946260462614626246263462644626546266462674626846269462704627146272462734627446275462764627746278462794628046281462824628346284462854628646287462884628946290462914629246293462944629546296462974629846299463004630146302463034630446305463064630746308463094631046311463124631346314463154631646317463184631946320463214632246323463244632546326463274632846329463304633146332463334633446335463364633746338463394634046341463424634346344463454634646347463484634946350463514635246353463544635546356463574635846359463604636146362463634636446365463664636746368463694637046371463724637346374463754637646377463784637946380463814638246383463844638546386463874638846389463904639146392463934639446395463964639746398463994640046401464024640346404464054640646407464084640946410464114641246413464144641546416464174641846419464204642146422464234642446425464264642746428464294643046431464324643346434464354643646437464384643946440464414644246443464444644546446464474644846449464504645146452464534645446455464564645746458464594646046461464624646346464464654646646467464684646946470464714647246473464744647546476464774647846479464804648146482464834648446485464864648746488464894649046491464924649346494464954649646497464984649946500465014650246503465044650546506465074650846509465104651146512465134651446515465164651746518465194652046521465224652346524465254652646527465284652946530465314653246533465344653546536465374653846539465404654146542465434654446545465464654746548465494655046551465524655346554465554655646557465584655946560465614656246563465644656546566465674656846569465704657146572465734657446575465764657746578465794658046581465824658346584465854658646587465884658946590465914659246593465944659546596465974659846599466004660146602466034660446605466064660746608466094661046611466124661346614466154661646617466184661946620466214662246623466244662546626466274662846629466304663146632466334663446635466364663746638466394664046641466424664346644466454664646647466484664946650466514665246653466544665546656466574665846659466604666146662466634666446665466664666746668466694667046671466724667346674466754667646677466784667946680466814668246683466844668546686466874668846689466904669146692466934669446695466964669746698466994670046701467024670346704467054670646707467084670946710467114671246713467144671546716467174671846719467204672146722467234672446725467264672746728467294673046731467324673346734467354673646737467384673946740467414674246743467444674546746467474674846749467504675146752467534675446755467564675746758467594676046761467624676346764467654676646767467684676946770467714677246773467744677546776467774677846779467804678146782467834678446785467864678746788467894679046791467924679346794467954679646797467984679946800468014680246803468044680546806468074680846809468104681146812468134681446815468164681746818468194682046821468224682346824468254682646827468284682946830468314683246833468344683546836468374683846839468404684146842468434684446845468464684746848468494685046851468524685346854468554685646857468584685946860468614686246863468644686546866468674686846869468704687146872468734687446875468764687746878468794688046881468824688346884468854688646887468884688946890468914689246893468944689546896468974689846899469004690146902469034690446905469064690746908469094691046911469124691346914469154691646917469184691946920469214692246923469244692546926469274692846929469304693146932469334693446935469364693746938469394694046941469424694346944469454694646947469484694946950469514695246953469544695546956469574695846959469604696146962469634696446965469664696746968469694697046971469724697346974469754697646977469784697946980469814698246983469844698546986469874698846989469904699146992469934699446995469964699746998469994700047001470024700347004470054700647007470084700947010470114701247013470144701547016470174701847019470204702147022470234702447025470264702747028470294703047031470324703347034470354703647037470384703947040470414704247043470444704547046470474704847049470504705147052470534705447055470564705747058470594706047061470624706347064470654706647067470684706947070470714707247073470744707547076470774707847079470804708147082470834708447085470864708747088470894709047091470924709347094470954709647097470984709947100471014710247103471044710547106471074710847109471104711147112471134711447115471164711747118471194712047121471224712347124471254712647127471284712947130471314713247133471344713547136471374713847139471404714147142471434714447145471464714747148471494715047151471524715347154471554715647157471584715947160471614716247163471644716547166471674716847169471704717147172471734717447175471764717747178471794718047181471824718347184471854718647187471884718947190471914719247193471944719547196471974719847199472004720147202472034720447205472064720747208472094721047211472124721347214472154721647217472184721947220472214722247223472244722547226472274722847229472304723147232472334723447235472364723747238472394724047241472424724347244472454724647247472484724947250472514725247253472544725547256472574725847259472604726147262472634726447265472664726747268472694727047271472724727347274472754727647277472784727947280472814728247283472844728547286472874728847289472904729147292472934729447295472964729747298472994730047301473024730347304473054730647307473084730947310473114731247313473144731547316473174731847319473204732147322473234732447325473264732747328473294733047331473324733347334473354733647337473384733947340473414734247343473444734547346473474734847349473504735147352473534735447355473564735747358473594736047361473624736347364473654736647367473684736947370473714737247373473744737547376473774737847379473804738147382473834738447385473864738747388473894739047391473924739347394473954739647397473984739947400474014740247403474044740547406474074740847409474104741147412474134741447415474164741747418474194742047421474224742347424474254742647427474284742947430474314743247433474344743547436474374743847439474404744147442474434744447445474464744747448474494745047451474524745347454474554745647457474584745947460474614746247463474644746547466474674746847469474704747147472474734747447475474764747747478474794748047481474824748347484474854748647487474884748947490474914749247493474944749547496474974749847499475004750147502475034750447505475064750747508475094751047511475124751347514475154751647517475184751947520475214752247523475244752547526475274752847529475304753147532475334753447535475364753747538475394754047541475424754347544475454754647547475484754947550475514755247553475544755547556475574755847559475604756147562475634756447565475664756747568475694757047571475724757347574475754757647577475784757947580475814758247583475844758547586475874758847589475904759147592475934759447595475964759747598475994760047601476024760347604476054760647607476084760947610476114761247613476144761547616476174761847619476204762147622476234762447625476264762747628476294763047631476324763347634476354763647637476384763947640476414764247643476444764547646476474764847649476504765147652476534765447655476564765747658476594766047661476624766347664476654766647667476684766947670476714767247673476744767547676476774767847679476804768147682476834768447685476864768747688476894769047691476924769347694476954769647697476984769947700477014770247703477044770547706477074770847709477104771147712477134771447715477164771747718477194772047721477224772347724477254772647727477284772947730477314773247733477344773547736477374773847739477404774147742477434774447745477464774747748477494775047751477524775347754477554775647757477584775947760477614776247763477644776547766477674776847769477704777147772477734777447775477764777747778477794778047781477824778347784477854778647787477884778947790477914779247793477944779547796477974779847799478004780147802478034780447805478064780747808478094781047811478124781347814478154781647817478184781947820478214782247823478244782547826478274782847829478304783147832478334783447835478364783747838478394784047841478424784347844478454784647847478484784947850478514785247853478544785547856478574785847859478604786147862478634786447865478664786747868478694787047871478724787347874478754787647877478784787947880478814788247883478844788547886478874788847889478904789147892478934789447895478964789747898478994790047901479024790347904479054790647907479084790947910479114791247913479144791547916479174791847919479204792147922479234792447925479264792747928479294793047931479324793347934479354793647937479384793947940479414794247943479444794547946479474794847949479504795147952479534795447955479564795747958479594796047961479624796347964479654796647967479684796947970479714797247973479744797547976479774797847979479804798147982479834798447985479864798747988479894799047991479924799347994479954799647997479984799948000480014800248003480044800548006480074800848009480104801148012480134801448015480164801748018480194802048021480224802348024480254802648027480284802948030480314803248033480344803548036480374803848039480404804148042480434804448045480464804748048480494805048051480524805348054480554805648057480584805948060480614806248063480644806548066480674806848069480704807148072480734807448075480764807748078480794808048081480824808348084480854808648087480884808948090480914809248093480944809548096480974809848099481004810148102481034810448105481064810748108481094811048111481124811348114481154811648117481184811948120481214812248123481244812548126481274812848129481304813148132481334813448135481364813748138481394814048141481424814348144481454814648147481484814948150481514815248153481544815548156481574815848159481604816148162481634816448165481664816748168481694817048171481724817348174481754817648177481784817948180481814818248183481844818548186481874818848189481904819148192481934819448195481964819748198481994820048201482024820348204482054820648207482084820948210482114821248213482144821548216482174821848219482204822148222482234822448225482264822748228482294823048231482324823348234482354823648237482384823948240482414824248243482444824548246482474824848249482504825148252482534825448255482564825748258482594826048261482624826348264482654826648267482684826948270482714827248273482744827548276482774827848279482804828148282482834828448285482864828748288482894829048291482924829348294482954829648297482984829948300483014830248303483044830548306483074830848309483104831148312483134831448315483164831748318483194832048321483224832348324483254832648327483284832948330483314833248333483344833548336483374833848339483404834148342483434834448345483464834748348483494835048351483524835348354483554835648357483584835948360483614836248363483644836548366483674836848369483704837148372483734837448375483764837748378483794838048381483824838348384483854838648387483884838948390483914839248393483944839548396483974839848399484004840148402484034840448405484064840748408484094841048411484124841348414484154841648417484184841948420484214842248423484244842548426484274842848429484304843148432484334843448435484364843748438484394844048441484424844348444484454844648447484484844948450484514845248453484544845548456484574845848459484604846148462484634846448465484664846748468484694847048471484724847348474484754847648477484784847948480484814848248483484844848548486484874848848489484904849148492484934849448495484964849748498484994850048501485024850348504485054850648507485084850948510485114851248513485144851548516485174851848519485204852148522485234852448525485264852748528485294853048531485324853348534485354853648537485384853948540485414854248543485444854548546485474854848549485504855148552485534855448555485564855748558485594856048561485624856348564485654856648567485684856948570485714857248573485744857548576485774857848579485804858148582485834858448585485864858748588485894859048591485924859348594485954859648597485984859948600486014860248603486044860548606486074860848609486104861148612486134861448615486164861748618486194862048621486224862348624486254862648627486284862948630486314863248633486344863548636486374863848639486404864148642486434864448645486464864748648486494865048651486524865348654486554865648657486584865948660486614866248663486644866548666486674866848669486704867148672486734867448675486764867748678486794868048681486824868348684486854868648687486884868948690486914869248693486944869548696486974869848699487004870148702487034870448705487064870748708487094871048711487124871348714487154871648717487184871948720487214872248723487244872548726487274872848729487304873148732487334873448735487364873748738487394874048741487424874348744487454874648747487484874948750487514875248753487544875548756487574875848759487604876148762487634876448765487664876748768487694877048771487724877348774487754877648777487784877948780487814878248783487844878548786487874878848789487904879148792487934879448795487964879748798487994880048801488024880348804488054880648807488084880948810488114881248813488144881548816488174881848819488204882148822488234882448825488264882748828488294883048831488324883348834488354883648837488384883948840488414884248843488444884548846488474884848849488504885148852488534885448855488564885748858488594886048861488624886348864488654886648867488684886948870488714887248873488744887548876488774887848879488804888148882488834888448885488864888748888488894889048891488924889348894488954889648897488984889948900489014890248903489044890548906489074890848909489104891148912489134891448915489164891748918489194892048921489224892348924489254892648927489284892948930489314893248933489344893548936489374893848939489404894148942489434894448945489464894748948489494895048951489524895348954489554895648957489584895948960489614896248963489644896548966489674896848969489704897148972489734897448975489764897748978489794898048981489824898348984489854898648987489884898948990489914899248993489944899548996489974899848999490004900149002490034900449005490064900749008490094901049011490124901349014490154901649017490184901949020490214902249023490244902549026490274902849029490304903149032490334903449035490364903749038490394904049041490424904349044490454904649047490484904949050490514905249053490544905549056490574905849059490604906149062490634906449065490664906749068490694907049071490724907349074490754907649077490784907949080490814908249083490844908549086490874908849089490904909149092490934909449095490964909749098490994910049101491024910349104491054910649107491084910949110491114911249113491144911549116491174911849119491204912149122491234912449125491264912749128491294913049131491324913349134491354913649137491384913949140491414914249143491444914549146491474914849149491504915149152491534915449155491564915749158491594916049161491624916349164491654916649167491684916949170491714917249173491744917549176491774917849179491804918149182491834918449185491864918749188491894919049191491924919349194491954919649197491984919949200492014920249203492044920549206492074920849209492104921149212492134921449215492164921749218492194922049221492224922349224492254922649227492284922949230492314923249233492344923549236492374923849239492404924149242492434924449245492464924749248492494925049251492524925349254492554925649257492584925949260492614926249263492644926549266492674926849269492704927149272492734927449275492764927749278492794928049281492824928349284492854928649287492884928949290492914929249293492944929549296492974929849299493004930149302493034930449305493064930749308493094931049311493124931349314493154931649317493184931949320493214932249323493244932549326493274932849329493304933149332493334933449335493364933749338493394934049341493424934349344493454934649347493484934949350493514935249353493544935549356493574935849359493604936149362493634936449365493664936749368493694937049371493724937349374493754937649377493784937949380493814938249383493844938549386493874938849389493904939149392493934939449395493964939749398493994940049401494024940349404494054940649407494084940949410494114941249413494144941549416494174941849419494204942149422494234942449425494264942749428494294943049431494324943349434494354943649437494384943949440494414944249443494444944549446494474944849449494504945149452494534945449455494564945749458494594946049461494624946349464494654946649467494684946949470494714947249473494744947549476494774947849479494804948149482494834948449485494864948749488494894949049491494924949349494494954949649497494984949949500495014950249503495044950549506495074950849509495104951149512495134951449515495164951749518495194952049521495224952349524495254952649527495284952949530495314953249533495344953549536495374953849539495404954149542495434954449545495464954749548495494955049551495524955349554495554955649557495584955949560495614956249563495644956549566495674956849569495704957149572495734957449575495764957749578495794958049581495824958349584495854958649587495884958949590495914959249593495944959549596495974959849599496004960149602496034960449605496064960749608496094961049611496124961349614496154961649617496184961949620496214962249623496244962549626496274962849629496304963149632496334963449635496364963749638496394964049641496424964349644496454964649647496484964949650496514965249653496544965549656496574965849659496604966149662496634966449665496664966749668496694967049671496724967349674496754967649677496784967949680496814968249683496844968549686496874968849689496904969149692496934969449695496964969749698496994970049701497024970349704497054970649707497084970949710497114971249713497144971549716497174971849719497204972149722497234972449725497264972749728497294973049731497324973349734497354973649737497384973949740497414974249743497444974549746497474974849749497504975149752497534975449755497564975749758497594976049761497624976349764497654976649767497684976949770497714977249773497744977549776497774977849779497804978149782497834978449785497864978749788497894979049791497924979349794497954979649797497984979949800498014980249803498044980549806498074980849809498104981149812498134981449815498164981749818498194982049821498224982349824498254982649827498284982949830498314983249833498344983549836498374983849839498404984149842498434984449845498464984749848498494985049851498524985349854498554985649857498584985949860498614986249863498644986549866498674986849869498704987149872498734987449875498764987749878498794988049881498824988349884498854988649887498884988949890498914989249893498944989549896498974989849899499004990149902499034990449905499064990749908499094991049911499124991349914499154991649917499184991949920499214992249923499244992549926499274992849929499304993149932499334993449935499364993749938499394994049941499424994349944499454994649947499484994949950499514995249953499544995549956499574995849959499604996149962499634996449965499664996749968499694997049971499724997349974499754997649977499784997949980499814998249983499844998549986499874998849989499904999149992499934999449995499964999749998499995000050001500025000350004500055000650007500085000950010500115001250013500145001550016500175001850019500205002150022500235002450025500265002750028500295003050031500325003350034500355003650037500385003950040500415004250043500445004550046500475004850049500505005150052500535005450055500565005750058500595006050061500625006350064500655006650067500685006950070500715007250073500745007550076500775007850079500805008150082500835008450085500865008750088500895009050091500925009350094500955009650097500985009950100501015010250103501045010550106501075010850109501105011150112501135011450115501165011750118501195012050121501225012350124501255012650127501285012950130501315013250133501345013550136501375013850139501405014150142501435014450145501465014750148501495015050151501525015350154501555015650157501585015950160501615016250163501645016550166501675016850169501705017150172501735017450175501765017750178501795018050181501825018350184501855018650187501885018950190501915019250193501945019550196501975019850199502005020150202502035020450205502065020750208502095021050211502125021350214502155021650217502185021950220502215022250223502245022550226502275022850229502305023150232502335023450235502365023750238502395024050241502425024350244502455024650247502485024950250502515025250253502545025550256502575025850259502605026150262502635026450265502665026750268502695027050271502725027350274502755027650277502785027950280502815028250283502845028550286502875028850289502905029150292502935029450295502965029750298502995030050301503025030350304503055030650307503085030950310503115031250313503145031550316503175031850319503205032150322503235032450325503265032750328503295033050331503325033350334503355033650337503385033950340503415034250343503445034550346503475034850349503505035150352503535035450355503565035750358503595036050361503625036350364503655036650367503685036950370503715037250373503745037550376503775037850379503805038150382503835038450385503865038750388503895039050391503925039350394503955039650397503985039950400504015040250403504045040550406504075040850409504105041150412504135041450415504165041750418504195042050421504225042350424504255042650427504285042950430504315043250433504345043550436504375043850439504405044150442504435044450445504465044750448504495045050451504525045350454504555045650457504585045950460504615046250463504645046550466504675046850469504705047150472504735047450475504765047750478504795048050481504825048350484504855048650487504885048950490504915049250493504945049550496504975049850499505005050150502505035050450505505065050750508505095051050511505125051350514505155051650517505185051950520505215052250523505245052550526505275052850529505305053150532505335053450535505365053750538505395054050541505425054350544505455054650547505485054950550505515055250553505545055550556505575055850559505605056150562505635056450565505665056750568505695057050571505725057350574505755057650577505785057950580505815058250583505845058550586505875058850589505905059150592505935059450595505965059750598505995060050601506025060350604506055060650607506085060950610506115061250613506145061550616506175061850619506205062150622506235062450625506265062750628506295063050631506325063350634506355063650637506385063950640506415064250643506445064550646506475064850649506505065150652506535065450655506565065750658506595066050661506625066350664506655066650667506685066950670506715067250673506745067550676506775067850679506805068150682506835068450685506865068750688506895069050691506925069350694506955069650697506985069950700507015070250703507045070550706507075070850709507105071150712507135071450715507165071750718507195072050721507225072350724507255072650727507285072950730507315073250733507345073550736507375073850739507405074150742507435074450745507465074750748507495075050751507525075350754507555075650757507585075950760507615076250763507645076550766507675076850769507705077150772507735077450775507765077750778507795078050781507825078350784507855078650787507885078950790507915079250793507945079550796507975079850799508005080150802508035080450805508065080750808508095081050811508125081350814508155081650817508185081950820508215082250823508245082550826508275082850829508305083150832508335083450835508365083750838508395084050841508425084350844508455084650847508485084950850508515085250853508545085550856508575085850859508605086150862508635086450865508665086750868508695087050871508725087350874508755087650877508785087950880508815088250883508845088550886508875088850889508905089150892508935089450895508965089750898508995090050901509025090350904509055090650907509085090950910509115091250913509145091550916509175091850919509205092150922509235092450925509265092750928509295093050931509325093350934509355093650937509385093950940509415094250943509445094550946509475094850949509505095150952509535095450955509565095750958509595096050961509625096350964509655096650967509685096950970509715097250973509745097550976509775097850979509805098150982509835098450985509865098750988509895099050991509925099350994509955099650997509985099951000510015100251003510045100551006510075100851009510105101151012510135101451015510165101751018510195102051021510225102351024510255102651027510285102951030510315103251033510345103551036510375103851039510405104151042510435104451045510465104751048510495105051051510525105351054510555105651057510585105951060510615106251063510645106551066510675106851069510705107151072510735107451075510765107751078510795108051081510825108351084510855108651087510885108951090510915109251093510945109551096510975109851099511005110151102511035110451105511065110751108511095111051111511125111351114511155111651117511185111951120511215112251123511245112551126511275112851129511305113151132511335113451135511365113751138511395114051141511425114351144511455114651147511485114951150511515115251153511545115551156511575115851159511605116151162511635116451165511665116751168511695117051171511725117351174511755117651177511785117951180511815118251183511845118551186511875118851189511905119151192511935119451195511965119751198511995120051201512025120351204512055120651207512085120951210512115121251213512145121551216512175121851219512205122151222512235122451225512265122751228512295123051231512325123351234512355123651237512385123951240512415124251243512445124551246512475124851249512505125151252512535125451255512565125751258512595126051261512625126351264512655126651267512685126951270512715127251273512745127551276512775127851279512805128151282512835128451285512865128751288512895129051291512925129351294512955129651297512985129951300513015130251303513045130551306513075130851309513105131151312513135131451315513165131751318513195132051321513225132351324513255132651327513285132951330513315133251333513345133551336513375133851339513405134151342513435134451345513465134751348513495135051351513525135351354513555135651357513585135951360513615136251363513645136551366513675136851369513705137151372513735137451375513765137751378513795138051381513825138351384513855138651387513885138951390513915139251393513945139551396513975139851399514005140151402514035140451405514065140751408514095141051411514125141351414514155141651417514185141951420514215142251423514245142551426514275142851429514305143151432514335143451435514365143751438514395144051441514425144351444514455144651447514485144951450514515145251453514545145551456514575145851459514605146151462514635146451465514665146751468514695147051471514725147351474514755147651477514785147951480514815148251483514845148551486514875148851489514905149151492514935149451495514965149751498514995150051501515025150351504515055150651507515085150951510515115151251513515145151551516515175151851519515205152151522515235152451525515265152751528515295153051531515325153351534515355153651537515385153951540515415154251543515445154551546515475154851549515505155151552515535155451555515565155751558515595156051561515625156351564515655156651567515685156951570515715157251573515745157551576515775157851579515805158151582515835158451585515865158751588515895159051591515925159351594515955159651597515985159951600516015160251603516045160551606516075160851609516105161151612516135161451615516165161751618516195162051621516225162351624516255162651627516285162951630516315163251633516345163551636516375163851639516405164151642516435164451645516465164751648516495165051651516525165351654516555165651657516585165951660516615166251663516645166551666516675166851669516705167151672516735167451675516765167751678516795168051681516825168351684516855168651687516885168951690516915169251693516945169551696516975169851699517005170151702517035170451705517065170751708517095171051711517125171351714517155171651717517185171951720517215172251723517245172551726517275172851729517305173151732517335173451735517365173751738517395174051741517425174351744517455174651747517485174951750517515175251753517545175551756517575175851759517605176151762517635176451765517665176751768517695177051771517725177351774517755177651777517785177951780517815178251783517845178551786517875178851789517905179151792517935179451795517965179751798517995180051801518025180351804518055180651807518085180951810518115181251813518145181551816518175181851819518205182151822518235182451825518265182751828518295183051831518325183351834518355183651837518385183951840518415184251843518445184551846518475184851849518505185151852518535185451855518565185751858518595186051861518625186351864518655186651867518685186951870518715187251873518745187551876518775187851879518805188151882518835188451885518865188751888518895189051891518925189351894518955189651897518985189951900519015190251903519045190551906519075190851909519105191151912519135191451915519165191751918519195192051921519225192351924519255192651927519285192951930519315193251933519345193551936519375193851939519405194151942519435194451945519465194751948519495195051951519525195351954519555195651957519585195951960519615196251963519645196551966519675196851969519705197151972519735197451975519765197751978519795198051981519825198351984519855198651987519885198951990519915199251993519945199551996519975199851999520005200152002520035200452005520065200752008520095201052011520125201352014520155201652017520185201952020520215202252023520245202552026520275202852029520305203152032520335203452035520365203752038520395204052041520425204352044520455204652047520485204952050520515205252053520545205552056520575205852059520605206152062520635206452065520665206752068520695207052071520725207352074520755207652077520785207952080520815208252083520845208552086520875208852089520905209152092520935209452095520965209752098520995210052101521025210352104521055210652107521085210952110521115211252113521145211552116521175211852119521205212152122521235212452125521265212752128521295213052131521325213352134521355213652137521385213952140521415214252143521445214552146521475214852149521505215152152521535215452155521565215752158521595216052161521625216352164521655216652167521685216952170521715217252173521745217552176521775217852179521805218152182521835218452185521865218752188521895219052191521925219352194521955219652197521985219952200522015220252203522045220552206522075220852209522105221152212522135221452215522165221752218522195222052221522225222352224522255222652227522285222952230522315223252233522345223552236522375223852239522405224152242522435224452245522465224752248522495225052251522525225352254522555225652257522585225952260522615226252263522645226552266522675226852269522705227152272522735227452275522765227752278522795228052281522825228352284522855228652287522885228952290522915229252293522945229552296522975229852299523005230152302523035230452305523065230752308523095231052311523125231352314523155231652317523185231952320523215232252323523245232552326523275232852329523305233152332523335233452335523365233752338523395234052341523425234352344523455234652347523485234952350523515235252353523545235552356523575235852359523605236152362523635236452365523665236752368523695237052371523725237352374523755237652377523785237952380523815238252383523845238552386523875238852389523905239152392523935239452395523965239752398523995240052401524025240352404524055240652407524085240952410524115241252413524145241552416524175241852419524205242152422524235242452425524265242752428524295243052431524325243352434524355243652437524385243952440524415244252443524445244552446524475244852449524505245152452524535245452455524565245752458524595246052461524625246352464524655246652467524685246952470524715247252473524745247552476524775247852479524805248152482524835248452485524865248752488524895249052491524925249352494524955249652497524985249952500525015250252503525045250552506525075250852509525105251152512525135251452515525165251752518525195252052521525225252352524525255252652527525285252952530525315253252533525345253552536525375253852539525405254152542525435254452545525465254752548525495255052551525525255352554525555255652557525585255952560525615256252563525645256552566525675256852569525705257152572525735257452575525765257752578525795258052581525825258352584525855258652587525885258952590525915259252593525945259552596525975259852599526005260152602526035260452605526065260752608526095261052611526125261352614526155261652617526185261952620526215262252623526245262552626526275262852629526305263152632526335263452635526365263752638526395264052641526425264352644526455264652647526485264952650526515265252653526545265552656526575265852659526605266152662526635266452665526665266752668526695267052671526725267352674526755267652677526785267952680526815268252683526845268552686526875268852689526905269152692526935269452695526965269752698526995270052701527025270352704527055270652707527085270952710527115271252713527145271552716527175271852719527205272152722527235272452725527265272752728527295273052731527325273352734527355273652737527385273952740527415274252743527445274552746527475274852749527505275152752527535275452755527565275752758527595276052761527625276352764527655276652767527685276952770527715277252773527745277552776527775277852779527805278152782527835278452785527865278752788527895279052791527925279352794527955279652797527985279952800528015280252803528045280552806528075280852809528105281152812528135281452815528165281752818528195282052821528225282352824528255282652827528285282952830528315283252833528345283552836528375283852839528405284152842528435284452845528465284752848528495285052851528525285352854528555285652857528585285952860528615286252863528645286552866528675286852869528705287152872528735287452875528765287752878528795288052881528825288352884528855288652887528885288952890528915289252893528945289552896528975289852899529005290152902529035290452905529065290752908529095291052911529125291352914529155291652917529185291952920529215292252923529245292552926529275292852929529305293152932529335293452935529365293752938529395294052941529425294352944529455294652947529485294952950529515295252953529545295552956529575295852959529605296152962529635296452965529665296752968529695297052971529725297352974529755297652977529785297952980529815298252983529845298552986529875298852989529905299152992529935299452995529965299752998529995300053001530025300353004530055300653007530085300953010530115301253013530145301553016530175301853019530205302153022530235302453025530265302753028530295303053031530325303353034530355303653037530385303953040530415304253043530445304553046530475304853049530505305153052530535305453055530565305753058530595306053061530625306353064530655306653067530685306953070530715307253073530745307553076530775307853079530805308153082530835308453085530865308753088530895309053091530925309353094530955309653097530985309953100531015310253103531045310553106531075310853109531105311153112531135311453115531165311753118531195312053121531225312353124531255312653127531285312953130531315313253133531345313553136531375313853139531405314153142531435314453145531465314753148531495315053151531525315353154531555315653157531585315953160531615316253163531645316553166531675316853169531705317153172531735317453175531765317753178531795318053181531825318353184531855318653187531885318953190531915319253193531945319553196531975319853199532005320153202532035320453205532065320753208532095321053211532125321353214532155321653217532185321953220532215322253223532245322553226532275322853229532305323153232532335323453235532365323753238532395324053241532425324353244532455324653247532485324953250532515325253253532545325553256532575325853259532605326153262532635326453265532665326753268532695327053271532725327353274532755327653277532785327953280532815328253283532845328553286532875328853289532905329153292532935329453295532965329753298532995330053301533025330353304533055330653307533085330953310533115331253313533145331553316533175331853319533205332153322533235332453325533265332753328533295333053331533325333353334533355333653337533385333953340533415334253343533445334553346533475334853349533505335153352533535335453355533565335753358533595336053361533625336353364533655336653367533685336953370533715337253373533745337553376533775337853379533805338153382533835338453385533865338753388533895339053391533925339353394533955339653397533985339953400534015340253403534045340553406534075340853409534105341153412534135341453415534165341753418534195342053421534225342353424534255342653427534285342953430534315343253433534345343553436534375343853439534405344153442534435344453445534465344753448534495345053451534525345353454534555345653457534585345953460534615346253463534645346553466534675346853469534705347153472534735347453475534765347753478534795348053481534825348353484534855348653487534885348953490534915349253493534945349553496534975349853499535005350153502535035350453505535065350753508535095351053511535125351353514535155351653517535185351953520535215352253523535245352553526535275352853529535305353153532535335353453535535365353753538535395354053541535425354353544535455354653547535485354953550535515355253553535545355553556535575355853559535605356153562535635356453565535665356753568535695357053571535725357353574535755357653577535785357953580535815358253583535845358553586535875358853589535905359153592535935359453595535965359753598535995360053601536025360353604536055360653607536085360953610536115361253613536145361553616536175361853619536205362153622536235362453625536265362753628536295363053631536325363353634536355363653637536385363953640536415364253643536445364553646536475364853649536505365153652536535365453655536565365753658536595366053661536625366353664536655366653667536685366953670536715367253673536745367553676536775367853679536805368153682536835368453685536865368753688536895369053691536925369353694536955369653697536985369953700537015370253703537045370553706537075370853709537105371153712537135371453715537165371753718537195372053721537225372353724537255372653727537285372953730537315373253733537345373553736537375373853739537405374153742537435374453745537465374753748537495375053751537525375353754537555375653757537585375953760537615376253763537645376553766537675376853769537705377153772537735377453775537765377753778537795378053781537825378353784537855378653787537885378953790537915379253793537945379553796537975379853799538005380153802538035380453805538065380753808538095381053811538125381353814538155381653817538185381953820538215382253823538245382553826538275382853829538305383153832538335383453835538365383753838538395384053841538425384353844538455384653847538485384953850538515385253853538545385553856538575385853859538605386153862538635386453865538665386753868538695387053871538725387353874538755387653877538785387953880538815388253883538845388553886538875388853889538905389153892538935389453895538965389753898538995390053901539025390353904539055390653907539085390953910539115391253913539145391553916539175391853919539205392153922539235392453925539265392753928539295393053931539325393353934539355393653937539385393953940539415394253943539445394553946539475394853949539505395153952539535395453955539565395753958539595396053961539625396353964539655396653967539685396953970539715397253973539745397553976539775397853979539805398153982539835398453985539865398753988539895399053991539925399353994539955399653997539985399954000540015400254003540045400554006540075400854009540105401154012540135401454015540165401754018540195402054021540225402354024540255402654027540285402954030540315403254033540345403554036540375403854039540405404154042540435404454045540465404754048540495405054051540525405354054540555405654057540585405954060540615406254063540645406554066540675406854069540705407154072540735407454075540765407754078540795408054081540825408354084540855408654087540885408954090540915409254093540945409554096540975409854099541005410154102541035410454105541065410754108541095411054111541125411354114541155411654117541185411954120541215412254123541245412554126541275412854129541305413154132541335413454135541365413754138541395414054141541425414354144541455414654147541485414954150541515415254153541545415554156541575415854159541605416154162541635416454165541665416754168541695417054171541725417354174541755417654177541785417954180541815418254183541845418554186541875418854189541905419154192541935419454195541965419754198541995420054201542025420354204542055420654207542085420954210542115421254213542145421554216542175421854219542205422154222542235422454225542265422754228542295423054231542325423354234542355423654237542385423954240542415424254243542445424554246542475424854249542505425154252542535425454255542565425754258542595426054261542625426354264542655426654267542685426954270542715427254273542745427554276542775427854279542805428154282542835428454285542865428754288542895429054291542925429354294542955429654297542985429954300543015430254303543045430554306543075430854309543105431154312543135431454315543165431754318543195432054321543225432354324543255432654327543285432954330543315433254333543345433554336543375433854339543405434154342543435434454345543465434754348543495435054351543525435354354543555435654357543585435954360543615436254363543645436554366543675436854369543705437154372543735437454375543765437754378543795438054381543825438354384543855438654387543885438954390543915439254393543945439554396543975439854399544005440154402544035440454405544065440754408544095441054411544125441354414544155441654417544185441954420544215442254423544245442554426544275442854429544305443154432544335443454435544365443754438544395444054441544425444354444544455444654447544485444954450544515445254453544545445554456544575445854459544605446154462544635446454465544665446754468544695447054471544725447354474544755447654477544785447954480544815448254483544845448554486544875448854489544905449154492544935449454495544965449754498544995450054501545025450354504545055450654507545085450954510545115451254513545145451554516545175451854519545205452154522545235452454525545265452754528545295453054531545325453354534545355453654537545385453954540545415454254543545445454554546545475454854549545505455154552545535455454555545565455754558545595456054561545625456354564545655456654567545685456954570545715457254573545745457554576545775457854579545805458154582545835458454585545865458754588545895459054591545925459354594545955459654597545985459954600546015460254603546045460554606546075460854609546105461154612546135461454615546165461754618546195462054621546225462354624546255462654627546285462954630546315463254633546345463554636546375463854639546405464154642546435464454645546465464754648546495465054651546525465354654546555465654657546585465954660546615466254663546645466554666546675466854669546705467154672546735467454675546765467754678546795468054681546825468354684546855468654687546885468954690546915469254693546945469554696546975469854699547005470154702547035470454705547065470754708547095471054711547125471354714547155471654717547185471954720547215472254723547245472554726547275472854729547305473154732547335473454735547365473754738547395474054741547425474354744547455474654747547485474954750547515475254753547545475554756547575475854759547605476154762547635476454765547665476754768547695477054771547725477354774547755477654777547785477954780547815478254783547845478554786547875478854789547905479154792547935479454795547965479754798547995480054801548025480354804548055480654807548085480954810548115481254813548145481554816548175481854819548205482154822548235482454825548265482754828548295483054831548325483354834548355483654837548385483954840548415484254843548445484554846548475484854849548505485154852548535485454855548565485754858548595486054861548625486354864548655486654867548685486954870548715487254873548745487554876548775487854879548805488154882548835488454885548865488754888548895489054891548925489354894548955489654897548985489954900549015490254903549045490554906549075490854909549105491154912549135491454915549165491754918549195492054921549225492354924549255492654927549285492954930549315493254933549345493554936549375493854939549405494154942549435494454945549465494754948549495495054951549525495354954549555495654957549585495954960549615496254963549645496554966549675496854969549705497154972549735497454975549765497754978549795498054981549825498354984549855498654987549885498954990549915499254993549945499554996549975499854999550005500155002550035500455005550065500755008550095501055011550125501355014550155501655017550185501955020550215502255023550245502555026550275502855029550305503155032550335503455035550365503755038550395504055041550425504355044550455504655047550485504955050550515505255053550545505555056550575505855059550605506155062550635506455065550665506755068550695507055071550725507355074550755507655077550785507955080550815508255083550845508555086550875508855089550905509155092550935509455095550965509755098550995510055101551025510355104551055510655107551085510955110551115511255113551145511555116551175511855119551205512155122551235512455125551265512755128551295513055131551325513355134551355513655137551385513955140551415514255143551445514555146551475514855149551505515155152551535515455155551565515755158551595516055161551625516355164551655516655167551685516955170551715517255173551745517555176551775517855179551805518155182551835518455185551865518755188551895519055191551925519355194551955519655197551985519955200552015520255203552045520555206552075520855209552105521155212552135521455215552165521755218552195522055221552225522355224552255522655227552285522955230552315523255233552345523555236552375523855239552405524155242552435524455245552465524755248552495525055251552525525355254552555525655257552585525955260552615526255263552645526555266552675526855269552705527155272552735527455275552765527755278552795528055281552825528355284552855528655287552885528955290552915529255293552945529555296552975529855299553005530155302553035530455305553065530755308553095531055311553125531355314553155531655317553185531955320553215532255323553245532555326553275532855329553305533155332553335533455335553365533755338553395534055341553425534355344553455534655347553485534955350553515535255353553545535555356553575535855359553605536155362553635536455365553665536755368553695537055371553725537355374553755537655377553785537955380553815538255383553845538555386553875538855389553905539155392553935539455395553965539755398553995540055401554025540355404554055540655407554085540955410554115541255413554145541555416554175541855419554205542155422554235542455425554265542755428554295543055431554325543355434554355543655437554385543955440554415544255443554445544555446554475544855449554505545155452554535545455455554565545755458554595546055461554625546355464554655546655467554685546955470554715547255473554745547555476554775547855479554805548155482554835548455485554865548755488554895549055491554925549355494554955549655497554985549955500555015550255503555045550555506555075550855509555105551155512555135551455515555165551755518555195552055521555225552355524555255552655527555285552955530555315553255533555345553555536555375553855539555405554155542555435554455545555465554755548555495555055551555525555355554555555555655557555585555955560555615556255563555645556555566555675556855569555705557155572555735557455575555765557755578555795558055581555825558355584555855558655587555885558955590555915559255593555945559555596555975559855599556005560155602556035560455605556065560755608556095561055611556125561355614556155561655617556185561955620556215562255623556245562555626556275562855629556305563155632556335563455635556365563755638556395564055641556425564355644556455564655647556485564955650556515565255653556545565555656556575565855659556605566155662556635566455665556665566755668556695567055671556725567355674556755567655677556785567955680556815568255683556845568555686556875568855689556905569155692556935569455695556965569755698556995570055701557025570355704557055570655707557085570955710557115571255713557145571555716557175571855719557205572155722557235572455725557265572755728557295573055731557325573355734557355573655737557385573955740557415574255743557445574555746557475574855749557505575155752557535575455755557565575755758557595576055761557625576355764557655576655767557685576955770557715577255773557745577555776557775577855779557805578155782557835578455785557865578755788557895579055791557925579355794557955579655797557985579955800558015580255803558045580555806558075580855809558105581155812558135581455815558165581755818558195582055821558225582355824558255582655827558285582955830558315583255833558345583555836558375583855839558405584155842558435584455845558465584755848558495585055851558525585355854558555585655857558585585955860558615586255863558645586555866558675586855869558705587155872558735587455875558765587755878558795588055881558825588355884558855588655887558885588955890558915589255893558945589555896558975589855899559005590155902559035590455905559065590755908559095591055911559125591355914559155591655917559185591955920559215592255923559245592555926559275592855929559305593155932559335593455935559365593755938559395594055941559425594355944559455594655947559485594955950559515595255953559545595555956559575595855959559605596155962559635596455965559665596755968559695597055971559725597355974559755597655977559785597955980559815598255983559845598555986559875598855989559905599155992559935599455995559965599755998559995600056001560025600356004560055600656007560085600956010560115601256013560145601556016560175601856019560205602156022560235602456025560265602756028560295603056031560325603356034560355603656037560385603956040560415604256043560445604556046560475604856049560505605156052560535605456055560565605756058560595606056061560625606356064560655606656067560685606956070560715607256073560745607556076560775607856079560805608156082560835608456085560865608756088560895609056091560925609356094560955609656097560985609956100561015610256103561045610556106561075610856109561105611156112561135611456115561165611756118561195612056121561225612356124561255612656127561285612956130561315613256133561345613556136561375613856139561405614156142561435614456145561465614756148561495615056151561525615356154561555615656157561585615956160561615616256163561645616556166561675616856169561705617156172561735617456175561765617756178561795618056181561825618356184561855618656187561885618956190561915619256193561945619556196561975619856199562005620156202562035620456205562065620756208562095621056211562125621356214562155621656217562185621956220562215622256223562245622556226562275622856229562305623156232562335623456235562365623756238562395624056241562425624356244562455624656247562485624956250562515625256253562545625556256562575625856259562605626156262562635626456265562665626756268562695627056271562725627356274562755627656277562785627956280562815628256283562845628556286562875628856289562905629156292562935629456295562965629756298562995630056301563025630356304563055630656307563085630956310563115631256313563145631556316563175631856319563205632156322563235632456325563265632756328563295633056331563325633356334563355633656337563385633956340563415634256343563445634556346563475634856349563505635156352563535635456355563565635756358563595636056361563625636356364563655636656367563685636956370563715637256373563745637556376563775637856379563805638156382563835638456385563865638756388563895639056391563925639356394563955639656397563985639956400564015640256403564045640556406564075640856409564105641156412564135641456415564165641756418564195642056421564225642356424564255642656427564285642956430564315643256433564345643556436564375643856439564405644156442564435644456445564465644756448564495645056451564525645356454564555645656457564585645956460564615646256463564645646556466564675646856469564705647156472564735647456475564765647756478564795648056481564825648356484564855648656487564885648956490564915649256493564945649556496564975649856499565005650156502565035650456505565065650756508565095651056511565125651356514565155651656517565185651956520565215652256523565245652556526565275652856529565305653156532565335653456535565365653756538565395654056541565425654356544565455654656547565485654956550565515655256553565545655556556565575655856559565605656156562565635656456565565665656756568565695657056571565725657356574565755657656577565785657956580565815658256583565845658556586565875658856589565905659156592565935659456595565965659756598565995660056601566025660356604566055660656607566085660956610566115661256613566145661556616566175661856619566205662156622566235662456625566265662756628566295663056631566325663356634566355663656637566385663956640566415664256643566445664556646566475664856649566505665156652566535665456655566565665756658566595666056661566625666356664566655666656667566685666956670566715667256673566745667556676566775667856679566805668156682566835668456685566865668756688566895669056691566925669356694566955669656697566985669956700567015670256703567045670556706567075670856709567105671156712567135671456715567165671756718567195672056721567225672356724567255672656727567285672956730567315673256733567345673556736567375673856739567405674156742567435674456745567465674756748567495675056751567525675356754567555675656757567585675956760567615676256763567645676556766567675676856769567705677156772567735677456775567765677756778567795678056781567825678356784567855678656787567885678956790567915679256793567945679556796567975679856799568005680156802568035680456805568065680756808568095681056811568125681356814568155681656817568185681956820568215682256823568245682556826568275682856829568305683156832568335683456835568365683756838568395684056841568425684356844568455684656847568485684956850568515685256853568545685556856568575685856859568605686156862568635686456865568665686756868568695687056871568725687356874568755687656877568785687956880568815688256883568845688556886568875688856889568905689156892568935689456895568965689756898568995690056901569025690356904569055690656907569085690956910569115691256913569145691556916569175691856919569205692156922569235692456925569265692756928569295693056931569325693356934569355693656937569385693956940569415694256943569445694556946569475694856949569505695156952569535695456955569565695756958569595696056961569625696356964569655696656967569685696956970569715697256973569745697556976569775697856979569805698156982569835698456985569865698756988569895699056991569925699356994569955699656997569985699957000570015700257003570045700557006570075700857009570105701157012570135701457015570165701757018570195702057021570225702357024570255702657027570285702957030570315703257033570345703557036570375703857039570405704157042570435704457045570465704757048570495705057051570525705357054570555705657057570585705957060570615706257063570645706557066570675706857069570705707157072570735707457075570765707757078570795708057081570825708357084570855708657087570885708957090570915709257093570945709557096570975709857099571005710157102571035710457105571065710757108571095711057111571125711357114571155711657117571185711957120571215712257123571245712557126571275712857129571305713157132571335713457135571365713757138571395714057141571425714357144571455714657147571485714957150571515715257153571545715557156571575715857159571605716157162571635716457165571665716757168571695717057171571725717357174571755717657177571785717957180571815718257183571845718557186571875718857189571905719157192571935719457195571965719757198571995720057201572025720357204572055720657207572085720957210572115721257213572145721557216572175721857219572205722157222572235722457225572265722757228572295723057231572325723357234572355723657237572385723957240572415724257243572445724557246572475724857249572505725157252572535725457255572565725757258572595726057261572625726357264572655726657267572685726957270572715727257273572745727557276572775727857279572805728157282572835728457285572865728757288572895729057291572925729357294572955729657297572985729957300573015730257303573045730557306573075730857309573105731157312573135731457315573165731757318573195732057321573225732357324573255732657327573285732957330573315733257333573345733557336573375733857339573405734157342573435734457345573465734757348573495735057351573525735357354573555735657357573585735957360573615736257363573645736557366573675736857369573705737157372573735737457375573765737757378573795738057381573825738357384573855738657387573885738957390573915739257393573945739557396573975739857399574005740157402574035740457405574065740757408574095741057411574125741357414574155741657417574185741957420574215742257423574245742557426574275742857429574305743157432574335743457435574365743757438574395744057441574425744357444574455744657447574485744957450574515745257453574545745557456574575745857459574605746157462574635746457465574665746757468574695747057471574725747357474574755747657477574785747957480574815748257483574845748557486574875748857489574905749157492574935749457495574965749757498574995750057501575025750357504575055750657507575085750957510575115751257513575145751557516575175751857519575205752157522575235752457525575265752757528575295753057531575325753357534575355753657537575385753957540575415754257543575445754557546575475754857549575505755157552575535755457555575565755757558575595756057561575625756357564575655756657567575685756957570575715757257573575745757557576575775757857579575805758157582575835758457585575865758757588575895759057591575925759357594575955759657597575985759957600576015760257603576045760557606576075760857609576105761157612576135761457615576165761757618576195762057621576225762357624576255762657627576285762957630576315763257633576345763557636576375763857639576405764157642576435764457645576465764757648576495765057651576525765357654576555765657657576585765957660576615766257663576645766557666576675766857669576705767157672576735767457675576765767757678576795768057681576825768357684576855768657687576885768957690576915769257693576945769557696576975769857699577005770157702577035770457705577065770757708577095771057711577125771357714577155771657717577185771957720577215772257723577245772557726577275772857729577305773157732577335773457735577365773757738577395774057741577425774357744577455774657747577485774957750577515775257753577545775557756577575775857759577605776157762577635776457765577665776757768577695777057771577725777357774577755777657777577785777957780577815778257783577845778557786577875778857789577905779157792577935779457795577965779757798577995780057801578025780357804578055780657807578085780957810578115781257813578145781557816578175781857819578205782157822578235782457825578265782757828578295783057831578325783357834578355783657837578385783957840578415784257843578445784557846578475784857849578505785157852578535785457855578565785757858578595786057861578625786357864578655786657867578685786957870578715787257873578745787557876578775787857879578805788157882578835788457885578865788757888578895789057891578925789357894578955789657897578985789957900579015790257903579045790557906579075790857909579105791157912579135791457915579165791757918579195792057921579225792357924579255792657927579285792957930579315793257933579345793557936579375793857939579405794157942579435794457945579465794757948579495795057951579525795357954579555795657957579585795957960579615796257963579645796557966579675796857969579705797157972579735797457975579765797757978579795798057981579825798357984579855798657987579885798957990579915799257993579945799557996579975799857999580005800158002580035800458005580065800758008580095801058011580125801358014580155801658017580185801958020580215802258023580245802558026580275802858029580305803158032580335803458035580365803758038580395804058041580425804358044580455804658047580485804958050580515805258053580545805558056580575805858059580605806158062580635806458065580665806758068580695807058071580725807358074580755807658077580785807958080580815808258083580845808558086580875808858089580905809158092580935809458095580965809758098580995810058101581025810358104581055810658107581085810958110581115811258113581145811558116581175811858119581205812158122581235812458125581265812758128581295813058131581325813358134581355813658137581385813958140581415814258143581445814558146581475814858149581505815158152581535815458155581565815758158581595816058161581625816358164581655816658167581685816958170581715817258173581745817558176581775817858179581805818158182581835818458185581865818758188581895819058191581925819358194581955819658197581985819958200582015820258203582045820558206582075820858209582105821158212582135821458215582165821758218582195822058221582225822358224582255822658227582285822958230582315823258233582345823558236582375823858239582405824158242582435824458245582465824758248582495825058251582525825358254582555825658257582585825958260582615826258263582645826558266582675826858269582705827158272582735827458275582765827758278582795828058281582825828358284582855828658287582885828958290582915829258293582945829558296582975829858299583005830158302583035830458305583065830758308583095831058311583125831358314583155831658317583185831958320583215832258323583245832558326583275832858329583305833158332583335833458335583365833758338583395834058341583425834358344583455834658347583485834958350583515835258353583545835558356583575835858359583605836158362583635836458365583665836758368583695837058371583725837358374583755837658377583785837958380583815838258383583845838558386583875838858389583905839158392583935839458395583965839758398583995840058401584025840358404584055840658407584085840958410584115841258413584145841558416584175841858419584205842158422584235842458425584265842758428584295843058431584325843358434584355843658437584385843958440584415844258443584445844558446584475844858449584505845158452584535845458455584565845758458584595846058461584625846358464584655846658467584685846958470584715847258473584745847558476584775847858479584805848158482584835848458485584865848758488584895849058491584925849358494584955849658497584985849958500585015850258503585045850558506585075850858509585105851158512585135851458515585165851758518585195852058521585225852358524585255852658527585285852958530585315853258533585345853558536585375853858539585405854158542585435854458545585465854758548585495855058551585525855358554585555855658557585585855958560585615856258563585645856558566585675856858569585705857158572585735857458575585765857758578585795858058581585825858358584585855858658587585885858958590585915859258593585945859558596585975859858599586005860158602586035860458605586065860758608586095861058611586125861358614586155861658617586185861958620586215862258623586245862558626586275862858629586305863158632586335863458635586365863758638586395864058641586425864358644586455864658647586485864958650586515865258653586545865558656586575865858659586605866158662586635866458665586665866758668586695867058671586725867358674586755867658677586785867958680586815868258683586845868558686586875868858689586905869158692586935869458695586965869758698586995870058701587025870358704587055870658707587085870958710587115871258713587145871558716587175871858719587205872158722587235872458725587265872758728587295873058731587325873358734587355873658737587385873958740587415874258743587445874558746587475874858749587505875158752587535875458755587565875758758587595876058761587625876358764587655876658767587685876958770587715877258773587745877558776587775877858779587805878158782587835878458785587865878758788587895879058791587925879358794587955879658797587985879958800588015880258803588045880558806588075880858809588105881158812588135881458815588165881758818588195882058821588225882358824588255882658827588285882958830588315883258833588345883558836588375883858839588405884158842588435884458845588465884758848588495885058851588525885358854588555885658857588585885958860588615886258863588645886558866588675886858869588705887158872588735887458875588765887758878588795888058881588825888358884588855888658887588885888958890588915889258893588945889558896588975889858899589005890158902589035890458905589065890758908589095891058911589125891358914589155891658917589185891958920589215892258923589245892558926589275892858929589305893158932589335893458935589365893758938589395894058941589425894358944589455894658947589485894958950589515895258953589545895558956589575895858959589605896158962589635896458965589665896758968589695897058971589725897358974589755897658977589785897958980589815898258983589845898558986589875898858989589905899158992589935899458995589965899758998589995900059001590025900359004590055900659007590085900959010590115901259013590145901559016590175901859019590205902159022590235902459025590265902759028590295903059031590325903359034590355903659037590385903959040590415904259043590445904559046590475904859049590505905159052590535905459055590565905759058590595906059061590625906359064590655906659067590685906959070590715907259073590745907559076590775907859079590805908159082590835908459085590865908759088590895909059091590925909359094590955909659097590985909959100591015910259103591045910559106591075910859109591105911159112591135911459115591165911759118591195912059121591225912359124591255912659127591285912959130591315913259133591345913559136591375913859139591405914159142591435914459145591465914759148591495915059151591525915359154591555915659157591585915959160591615916259163591645916559166591675916859169591705917159172591735917459175591765917759178591795918059181591825918359184591855918659187591885918959190591915919259193591945919559196591975919859199592005920159202592035920459205592065920759208592095921059211592125921359214592155921659217592185921959220592215922259223592245922559226592275922859229592305923159232592335923459235592365923759238592395924059241592425924359244592455924659247592485924959250592515925259253592545925559256592575925859259592605926159262592635926459265592665926759268592695927059271592725927359274592755927659277592785927959280592815928259283592845928559286592875928859289592905929159292592935929459295592965929759298592995930059301593025930359304593055930659307593085930959310593115931259313593145931559316593175931859319593205932159322593235932459325593265932759328593295933059331593325933359334593355933659337593385933959340593415934259343593445934559346593475934859349593505935159352593535935459355593565935759358593595936059361593625936359364593655936659367593685936959370593715937259373593745937559376593775937859379593805938159382593835938459385593865938759388593895939059391593925939359394593955939659397593985939959400594015940259403594045940559406594075940859409594105941159412594135941459415594165941759418594195942059421594225942359424594255942659427594285942959430594315943259433594345943559436594375943859439594405944159442594435944459445594465944759448594495945059451594525945359454594555945659457594585945959460594615946259463594645946559466594675946859469594705947159472594735947459475594765947759478594795948059481594825948359484594855948659487594885948959490594915949259493594945949559496594975949859499595005950159502595035950459505595065950759508595095951059511595125951359514595155951659517595185951959520595215952259523595245952559526595275952859529595305953159532595335953459535595365953759538595395954059541595425954359544595455954659547595485954959550595515955259553595545955559556595575955859559595605956159562595635956459565595665956759568595695957059571595725957359574595755957659577595785957959580595815958259583595845958559586595875958859589595905959159592595935959459595595965959759598595995960059601596025960359604596055960659607596085960959610596115961259613596145961559616596175961859619596205962159622596235962459625596265962759628596295963059631596325963359634596355963659637596385963959640596415964259643596445964559646596475964859649596505965159652596535965459655596565965759658596595966059661596625966359664596655966659667596685966959670596715967259673596745967559676596775967859679596805968159682596835968459685596865968759688596895969059691596925969359694596955969659697596985969959700597015970259703597045970559706597075970859709597105971159712597135971459715597165971759718597195972059721597225972359724597255972659727597285972959730597315973259733597345973559736597375973859739597405974159742597435974459745597465974759748597495975059751597525975359754597555975659757597585975959760597615976259763597645976559766597675976859769597705977159772597735977459775597765977759778597795978059781597825978359784597855978659787597885978959790597915979259793597945979559796597975979859799598005980159802598035980459805598065980759808598095981059811598125981359814598155981659817598185981959820598215982259823598245982559826598275982859829598305983159832598335983459835598365983759838598395984059841598425984359844598455984659847598485984959850598515985259853598545985559856598575985859859598605986159862598635986459865598665986759868598695987059871598725987359874598755987659877598785987959880598815988259883598845988559886598875988859889598905989159892598935989459895598965989759898598995990059901599025990359904599055990659907599085990959910599115991259913599145991559916599175991859919599205992159922599235992459925599265992759928599295993059931599325993359934599355993659937599385993959940599415994259943599445994559946599475994859949599505995159952599535995459955599565995759958599595996059961599625996359964599655996659967599685996959970599715997259973599745997559976599775997859979599805998159982599835998459985599865998759988599895999059991599925999359994599955999659997599985999960000600016000260003600046000560006600076000860009600106001160012600136001460015600166001760018600196002060021600226002360024600256002660027600286002960030600316003260033600346003560036600376003860039600406004160042600436004460045600466004760048600496005060051600526005360054600556005660057600586005960060600616006260063600646006560066600676006860069600706007160072600736007460075600766007760078600796008060081600826008360084600856008660087600886008960090600916009260093600946009560096600976009860099601006010160102601036010460105601066010760108601096011060111601126011360114601156011660117601186011960120601216012260123601246012560126601276012860129601306013160132601336013460135601366013760138601396014060141601426014360144601456014660147601486014960150601516015260153601546015560156601576015860159601606016160162601636016460165601666016760168601696017060171601726017360174601756017660177601786017960180601816018260183601846018560186601876018860189601906019160192601936019460195601966019760198601996020060201602026020360204602056020660207602086020960210602116021260213602146021560216602176021860219602206022160222602236022460225602266022760228602296023060231602326023360234602356023660237602386023960240602416024260243602446024560246602476024860249602506025160252602536025460255602566025760258602596026060261602626026360264602656026660267602686026960270602716027260273602746027560276602776027860279602806028160282602836028460285602866028760288602896029060291602926029360294602956029660297602986029960300603016030260303603046030560306603076030860309603106031160312603136031460315603166031760318603196032060321603226032360324603256032660327603286032960330603316033260333603346033560336603376033860339603406034160342603436034460345603466034760348603496035060351603526035360354603556035660357603586035960360603616036260363603646036560366603676036860369603706037160372603736037460375603766037760378603796038060381603826038360384603856038660387603886038960390603916039260393603946039560396603976039860399604006040160402604036040460405604066040760408604096041060411604126041360414604156041660417604186041960420604216042260423604246042560426604276042860429604306043160432604336043460435604366043760438604396044060441604426044360444604456044660447604486044960450604516045260453604546045560456604576045860459604606046160462604636046460465604666046760468604696047060471604726047360474604756047660477604786047960480604816048260483604846048560486604876048860489604906049160492604936049460495604966049760498604996050060501605026050360504605056050660507605086050960510605116051260513605146051560516605176051860519605206052160522605236052460525605266052760528605296053060531605326053360534605356053660537605386053960540605416054260543605446054560546605476054860549605506055160552605536055460555605566055760558605596056060561605626056360564605656056660567605686056960570605716057260573605746057560576605776057860579605806058160582605836058460585605866058760588605896059060591605926059360594605956059660597605986059960600606016060260603606046060560606606076060860609606106061160612606136061460615606166061760618606196062060621606226062360624606256062660627606286062960630606316063260633606346063560636606376063860639606406064160642606436064460645606466064760648606496065060651606526065360654606556065660657606586065960660606616066260663606646066560666606676066860669606706067160672606736067460675606766067760678606796068060681606826068360684606856068660687606886068960690606916069260693606946069560696606976069860699607006070160702607036070460705607066070760708607096071060711607126071360714607156071660717607186071960720607216072260723607246072560726607276072860729607306073160732607336073460735607366073760738607396074060741607426074360744607456074660747607486074960750607516075260753607546075560756607576075860759607606076160762607636076460765607666076760768607696077060771607726077360774607756077660777607786077960780607816078260783607846078560786607876078860789607906079160792607936079460795607966079760798607996080060801608026080360804608056080660807608086080960810608116081260813608146081560816608176081860819608206082160822608236082460825608266082760828608296083060831608326083360834608356083660837608386083960840608416084260843608446084560846608476084860849608506085160852608536085460855608566085760858608596086060861608626086360864608656086660867608686086960870608716087260873608746087560876608776087860879608806088160882608836088460885608866088760888608896089060891608926089360894608956089660897608986089960900609016090260903609046090560906609076090860909609106091160912609136091460915609166091760918609196092060921609226092360924609256092660927609286092960930609316093260933609346093560936609376093860939609406094160942609436094460945609466094760948609496095060951609526095360954609556095660957609586095960960609616096260963609646096560966609676096860969609706097160972609736097460975609766097760978609796098060981609826098360984609856098660987609886098960990609916099260993609946099560996609976099860999610006100161002610036100461005610066100761008610096101061011610126101361014610156101661017610186101961020610216102261023610246102561026610276102861029610306103161032610336103461035610366103761038610396104061041610426104361044610456104661047610486104961050610516105261053610546105561056610576105861059610606106161062610636106461065610666106761068610696107061071610726107361074610756107661077610786107961080610816108261083610846108561086610876108861089610906109161092610936109461095610966109761098610996110061101611026110361104611056110661107611086110961110611116111261113611146111561116611176111861119611206112161122611236112461125611266112761128611296113061131611326113361134611356113661137611386113961140611416114261143611446114561146611476114861149611506115161152611536115461155611566115761158611596116061161611626116361164611656116661167611686116961170611716117261173611746117561176611776117861179611806118161182611836118461185611866118761188611896119061191611926119361194611956119661197611986119961200612016120261203612046120561206612076120861209612106121161212612136121461215612166121761218612196122061221612226122361224612256122661227612286122961230612316123261233612346123561236612376123861239612406124161242612436124461245612466124761248612496125061251612526125361254612556125661257612586125961260612616126261263612646126561266612676126861269612706127161272612736127461275612766127761278612796128061281612826128361284612856128661287612886128961290612916129261293612946129561296612976129861299613006130161302613036130461305613066130761308613096131061311613126131361314613156131661317613186131961320613216132261323613246132561326613276132861329613306133161332613336133461335613366133761338613396134061341613426134361344613456134661347613486134961350613516135261353613546135561356613576135861359613606136161362613636136461365613666136761368613696137061371613726137361374613756137661377613786137961380613816138261383613846138561386613876138861389613906139161392613936139461395613966139761398613996140061401614026140361404614056140661407614086140961410614116141261413614146141561416614176141861419614206142161422614236142461425614266142761428614296143061431614326143361434614356143661437614386143961440614416144261443614446144561446614476144861449614506145161452614536145461455614566145761458614596146061461614626146361464614656146661467614686146961470614716147261473614746147561476614776147861479614806148161482614836148461485614866148761488614896149061491614926149361494614956149661497614986149961500615016150261503615046150561506615076150861509615106151161512615136151461515615166151761518615196152061521615226152361524615256152661527615286152961530615316153261533615346153561536615376153861539615406154161542615436154461545615466154761548615496155061551615526155361554615556155661557615586155961560615616156261563615646156561566615676156861569615706157161572615736157461575615766157761578615796158061581615826158361584615856158661587615886158961590615916159261593615946159561596615976159861599616006160161602616036160461605616066160761608616096161061611616126161361614616156161661617616186161961620616216162261623616246162561626616276162861629616306163161632616336163461635616366163761638616396164061641616426164361644616456164661647616486164961650616516165261653616546165561656616576165861659616606166161662616636166461665616666166761668616696167061671616726167361674616756167661677616786167961680616816168261683616846168561686616876168861689616906169161692616936169461695616966169761698616996170061701617026170361704617056170661707617086170961710617116171261713617146171561716617176171861719617206172161722617236172461725617266172761728617296173061731617326173361734617356173661737617386173961740617416174261743617446174561746617476174861749617506175161752617536175461755617566175761758617596176061761617626176361764617656176661767617686176961770617716177261773617746177561776617776177861779617806178161782617836178461785617866178761788617896179061791617926179361794617956179661797617986179961800618016180261803618046180561806618076180861809618106181161812618136181461815618166181761818618196182061821618226182361824618256182661827618286182961830618316183261833618346183561836618376183861839618406184161842618436184461845618466184761848618496185061851618526185361854618556185661857618586185961860618616186261863618646186561866618676186861869618706187161872618736187461875618766187761878618796188061881618826188361884618856188661887618886188961890618916189261893618946189561896618976189861899619006190161902619036190461905619066190761908619096191061911619126191361914619156191661917619186191961920619216192261923619246192561926619276192861929619306193161932619336193461935619366193761938619396194061941619426194361944619456194661947619486194961950619516195261953619546195561956619576195861959619606196161962619636196461965619666196761968619696197061971619726197361974619756197661977619786197961980619816198261983619846198561986619876198861989619906199161992619936199461995619966199761998619996200062001620026200362004620056200662007620086200962010620116201262013620146201562016620176201862019620206202162022620236202462025620266202762028620296203062031620326203362034620356203662037620386203962040620416204262043620446204562046620476204862049620506205162052620536205462055620566205762058620596206062061620626206362064620656206662067620686206962070620716207262073620746207562076620776207862079620806208162082620836208462085620866208762088620896209062091620926209362094620956209662097620986209962100621016210262103621046210562106621076210862109621106211162112621136211462115621166211762118621196212062121621226212362124621256212662127621286212962130621316213262133621346213562136621376213862139621406214162142621436214462145621466214762148621496215062151621526215362154621556215662157621586215962160621616216262163621646216562166621676216862169621706217162172621736217462175621766217762178621796218062181621826218362184621856218662187621886218962190621916219262193621946219562196621976219862199622006220162202622036220462205622066220762208622096221062211622126221362214622156221662217622186221962220622216222262223622246222562226622276222862229622306223162232622336223462235622366223762238622396224062241622426224362244622456224662247622486224962250622516225262253622546225562256622576225862259622606226162262622636226462265622666226762268622696227062271622726227362274622756227662277622786227962280622816228262283622846228562286622876228862289622906229162292622936229462295622966229762298622996230062301623026230362304623056230662307623086230962310623116231262313623146231562316623176231862319623206232162322623236232462325623266232762328623296233062331623326233362334623356233662337623386233962340623416234262343623446234562346623476234862349623506235162352623536235462355623566235762358623596236062361623626236362364623656236662367623686236962370623716237262373623746237562376623776237862379623806238162382623836238462385623866238762388623896239062391623926239362394623956239662397623986239962400624016240262403624046240562406624076240862409624106241162412624136241462415624166241762418624196242062421624226242362424624256242662427624286242962430624316243262433624346243562436624376243862439624406244162442624436244462445624466244762448624496245062451624526245362454624556245662457624586245962460624616246262463624646246562466624676246862469624706247162472624736247462475624766247762478624796248062481624826248362484624856248662487624886248962490624916249262493624946249562496624976249862499625006250162502625036250462505625066250762508625096251062511625126251362514625156251662517625186251962520625216252262523625246252562526625276252862529625306253162532625336253462535625366253762538625396254062541625426254362544625456254662547625486254962550625516255262553625546255562556625576255862559625606256162562625636256462565625666256762568625696257062571625726257362574625756257662577625786257962580625816258262583625846258562586625876258862589625906259162592625936259462595625966259762598625996260062601626026260362604626056260662607626086260962610626116261262613626146261562616626176261862619626206262162622626236262462625626266262762628626296263062631626326263362634626356263662637626386263962640626416264262643626446264562646626476264862649626506265162652626536265462655626566265762658626596266062661626626266362664626656266662667626686266962670626716267262673626746267562676626776267862679626806268162682626836268462685626866268762688626896269062691626926269362694626956269662697626986269962700627016270262703627046270562706627076270862709627106271162712627136271462715627166271762718627196272062721627226272362724627256272662727627286272962730627316273262733627346273562736627376273862739627406274162742627436274462745627466274762748627496275062751627526275362754627556275662757627586275962760627616276262763627646276562766627676276862769627706277162772627736277462775627766277762778627796278062781627826278362784627856278662787627886278962790627916279262793627946279562796627976279862799628006280162802628036280462805628066280762808628096281062811628126281362814628156281662817628186281962820628216282262823628246282562826628276282862829628306283162832628336283462835628366283762838628396284062841628426284362844628456284662847628486284962850628516285262853628546285562856628576285862859628606286162862628636286462865628666286762868628696287062871628726287362874628756287662877628786287962880628816288262883628846288562886628876288862889628906289162892628936289462895628966289762898628996290062901629026290362904629056290662907629086290962910629116291262913629146291562916629176291862919629206292162922629236292462925629266292762928629296293062931629326293362934629356293662937629386293962940629416294262943629446294562946629476294862949629506295162952629536295462955629566295762958629596296062961629626296362964629656296662967629686296962970629716297262973629746297562976629776297862979629806298162982629836298462985629866298762988629896299062991629926299362994629956299662997629986299963000630016300263003630046300563006630076300863009630106301163012630136301463015630166301763018630196302063021630226302363024630256302663027630286302963030630316303263033630346303563036630376303863039630406304163042630436304463045630466304763048630496305063051630526305363054630556305663057630586305963060630616306263063630646306563066630676306863069630706307163072630736307463075630766307763078630796308063081630826308363084630856308663087630886308963090630916309263093630946309563096630976309863099631006310163102631036310463105631066310763108631096311063111631126311363114631156311663117631186311963120631216312263123631246312563126631276312863129631306313163132631336313463135631366313763138631396314063141631426314363144631456314663147631486314963150631516315263153631546315563156631576315863159631606316163162631636316463165631666316763168631696317063171631726317363174631756317663177631786317963180631816318263183631846318563186631876318863189631906319163192631936319463195631966319763198631996320063201632026320363204632056320663207632086320963210632116321263213632146321563216632176321863219632206322163222632236322463225632266322763228632296323063231632326323363234632356323663237632386323963240632416324263243632446324563246632476324863249632506325163252632536325463255632566325763258632596326063261632626326363264632656326663267632686326963270632716327263273632746327563276632776327863279632806328163282632836328463285632866328763288632896329063291632926329363294632956329663297632986329963300633016330263303633046330563306633076330863309633106331163312633136331463315633166331763318633196332063321633226332363324633256332663327633286332963330633316333263333633346333563336633376333863339633406334163342633436334463345633466334763348633496335063351633526335363354633556335663357633586335963360633616336263363633646336563366633676336863369633706337163372633736337463375633766337763378633796338063381633826338363384633856338663387633886338963390633916339263393633946339563396633976339863399634006340163402634036340463405634066340763408634096341063411634126341363414634156341663417634186341963420634216342263423634246342563426634276342863429634306343163432634336343463435634366343763438634396344063441634426344363444634456344663447634486344963450634516345263453634546345563456634576345863459634606346163462634636346463465634666346763468634696347063471634726347363474634756347663477634786347963480634816348263483634846348563486634876348863489634906349163492634936349463495634966349763498634996350063501635026350363504635056350663507635086350963510635116351263513635146351563516635176351863519635206352163522635236352463525635266352763528635296353063531635326353363534635356353663537635386353963540635416354263543635446354563546635476354863549635506355163552635536355463555635566355763558635596356063561635626356363564635656356663567635686356963570635716357263573635746357563576635776357863579635806358163582635836358463585635866358763588635896359063591635926359363594635956359663597635986359963600636016360263603636046360563606636076360863609636106361163612636136361463615636166361763618636196362063621636226362363624636256362663627636286362963630636316363263633636346363563636636376363863639636406364163642636436364463645636466364763648636496365063651636526365363654636556365663657636586365963660636616366263663636646366563666636676366863669636706367163672636736367463675636766367763678636796368063681636826368363684636856368663687636886368963690636916369263693636946369563696636976369863699637006370163702637036370463705637066370763708637096371063711637126371363714637156371663717637186371963720637216372263723637246372563726637276372863729637306373163732637336373463735637366373763738637396374063741637426374363744637456374663747637486374963750637516375263753637546375563756637576375863759637606376163762637636376463765637666376763768637696377063771637726377363774637756377663777637786377963780637816378263783637846378563786637876378863789637906379163792637936379463795637966379763798637996380063801638026380363804638056380663807638086380963810638116381263813638146381563816638176381863819638206382163822638236382463825638266382763828638296383063831638326383363834638356383663837638386383963840638416384263843638446384563846638476384863849638506385163852638536385463855638566385763858638596386063861638626386363864638656386663867638686386963870638716387263873638746387563876638776387863879638806388163882638836388463885638866388763888638896389063891638926389363894638956389663897638986389963900639016390263903639046390563906639076390863909639106391163912639136391463915639166391763918639196392063921639226392363924639256392663927639286392963930639316393263933639346393563936639376393863939639406394163942639436394463945639466394763948639496395063951639526395363954639556395663957639586395963960639616396263963639646396563966639676396863969639706397163972639736397463975639766397763978639796398063981639826398363984639856398663987639886398963990639916399263993639946399563996639976399863999640006400164002640036400464005640066400764008640096401064011640126401364014640156401664017640186401964020640216402264023640246402564026640276402864029640306403164032640336403464035640366403764038640396404064041640426404364044640456404664047640486404964050640516405264053640546405564056640576405864059640606406164062640636406464065640666406764068640696407064071640726407364074640756407664077640786407964080640816408264083640846408564086640876408864089640906409164092640936409464095640966409764098640996410064101641026410364104641056410664107641086410964110641116411264113641146411564116641176411864119641206412164122641236412464125641266412764128641296413064131641326413364134641356413664137641386413964140641416414264143641446414564146641476414864149641506415164152641536415464155641566415764158641596416064161641626416364164641656416664167641686416964170641716417264173641746417564176641776417864179641806418164182641836418464185641866418764188641896419064191641926419364194641956419664197641986419964200642016420264203642046420564206642076420864209642106421164212642136421464215642166421764218642196422064221642226422364224642256422664227642286422964230642316423264233642346423564236642376423864239642406424164242642436424464245642466424764248642496425064251642526425364254642556425664257642586425964260642616426264263642646426564266642676426864269642706427164272642736427464275642766427764278642796428064281642826428364284642856428664287642886428964290642916429264293642946429564296642976429864299643006430164302643036430464305643066430764308643096431064311643126431364314643156431664317643186431964320643216432264323643246432564326643276432864329643306433164332643336433464335643366433764338643396434064341643426434364344643456434664347643486434964350643516435264353643546435564356643576435864359643606436164362643636436464365643666436764368643696437064371643726437364374643756437664377643786437964380643816438264383643846438564386643876438864389643906439164392643936439464395643966439764398643996440064401644026440364404644056440664407644086440964410644116441264413644146441564416644176441864419644206442164422644236442464425644266442764428644296443064431644326443364434644356443664437644386443964440644416444264443644446444564446644476444864449644506445164452644536445464455644566445764458644596446064461644626446364464644656446664467644686446964470644716447264473644746447564476644776447864479644806448164482644836448464485644866448764488644896449064491644926449364494644956449664497644986449964500645016450264503645046450564506645076450864509645106451164512645136451464515645166451764518645196452064521645226452364524645256452664527645286452964530645316453264533645346453564536645376453864539645406454164542645436454464545645466454764548645496455064551645526455364554645556455664557645586455964560645616456264563645646456564566645676456864569645706457164572645736457464575645766457764578645796458064581645826458364584645856458664587645886458964590645916459264593645946459564596645976459864599646006460164602646036460464605646066460764608646096461064611646126461364614646156461664617646186461964620646216462264623646246462564626646276462864629646306463164632646336463464635646366463764638646396464064641646426464364644646456464664647646486464964650646516465264653646546465564656646576465864659646606466164662646636466464665646666466764668646696467064671646726467364674646756467664677646786467964680646816468264683646846468564686646876468864689646906469164692646936469464695646966469764698646996470064701647026470364704647056470664707647086470964710647116471264713647146471564716647176471864719647206472164722647236472464725647266472764728647296473064731647326473364734647356473664737647386473964740647416474264743647446474564746647476474864749647506475164752647536475464755647566475764758647596476064761647626476364764647656476664767647686476964770647716477264773647746477564776647776477864779647806478164782647836478464785647866478764788647896479064791647926479364794647956479664797647986479964800648016480264803648046480564806648076480864809648106481164812648136481464815648166481764818648196482064821648226482364824648256482664827648286482964830648316483264833648346483564836648376483864839648406484164842648436484464845648466484764848648496485064851648526485364854648556485664857648586485964860648616486264863648646486564866648676486864869648706487164872648736487464875648766487764878648796488064881648826488364884648856488664887648886488964890648916489264893648946489564896648976489864899649006490164902649036490464905649066490764908649096491064911649126491364914649156491664917649186491964920649216492264923649246492564926649276492864929649306493164932649336493464935649366493764938649396494064941649426494364944649456494664947649486494964950649516495264953649546495564956649576495864959649606496164962649636496464965649666496764968649696497064971649726497364974649756497664977649786497964980649816498264983649846498564986649876498864989649906499164992649936499464995649966499764998649996500065001650026500365004650056500665007650086500965010650116501265013650146501565016650176501865019650206502165022650236502465025650266502765028650296503065031650326503365034650356503665037650386503965040650416504265043650446504565046650476504865049650506505165052650536505465055650566505765058650596506065061650626506365064650656506665067650686506965070650716507265073650746507565076650776507865079650806508165082650836508465085650866508765088650896509065091650926509365094650956509665097650986509965100651016510265103651046510565106651076510865109651106511165112651136511465115651166511765118651196512065121651226512365124651256512665127651286512965130651316513265133651346513565136651376513865139651406514165142651436514465145651466514765148651496515065151651526515365154651556515665157651586515965160651616516265163651646516565166651676516865169651706517165172651736517465175651766517765178651796518065181651826518365184651856518665187651886518965190651916519265193651946519565196651976519865199652006520165202652036520465205652066520765208652096521065211652126521365214652156521665217652186521965220652216522265223652246522565226652276522865229652306523165232652336523465235652366523765238652396524065241652426524365244652456524665247652486524965250652516525265253652546525565256652576525865259652606526165262652636526465265652666526765268652696527065271652726527365274652756527665277652786527965280652816528265283652846528565286652876528865289652906529165292652936529465295652966529765298652996530065301653026530365304653056530665307653086530965310653116531265313653146531565316653176531865319653206532165322653236532465325653266532765328653296533065331653326533365334653356533665337653386533965340653416534265343653446534565346653476534865349653506535165352653536535465355653566535765358653596536065361653626536365364653656536665367653686536965370653716537265373653746537565376653776537865379653806538165382653836538465385653866538765388653896539065391653926539365394653956539665397653986539965400654016540265403654046540565406654076540865409654106541165412654136541465415654166541765418654196542065421654226542365424654256542665427654286542965430654316543265433654346543565436654376543865439654406544165442654436544465445654466544765448654496545065451654526545365454654556545665457654586545965460654616546265463654646546565466654676546865469654706547165472654736547465475654766547765478654796548065481654826548365484654856548665487654886548965490654916549265493654946549565496654976549865499655006550165502655036550465505655066550765508655096551065511655126551365514655156551665517655186551965520655216552265523655246552565526655276552865529655306553165532655336553465535655366553765538655396554065541655426554365544655456554665547655486554965550655516555265553655546555565556655576555865559655606556165562655636556465565655666556765568655696557065571655726557365574655756557665577655786557965580655816558265583655846558565586655876558865589655906559165592655936559465595655966559765598655996560065601656026560365604656056560665607656086560965610656116561265613656146561565616656176561865619656206562165622656236562465625656266562765628656296563065631656326563365634656356563665637656386563965640656416564265643656446564565646656476564865649656506565165652656536565465655656566565765658656596566065661656626566365664656656566665667656686566965670656716567265673656746567565676656776567865679656806568165682656836568465685656866568765688656896569065691656926569365694656956569665697656986569965700657016570265703657046570565706657076570865709657106571165712657136571465715657166571765718657196572065721657226572365724657256572665727657286572965730657316573265733657346573565736657376573865739657406574165742657436574465745657466574765748657496575065751657526575365754657556575665757657586575965760657616576265763657646576565766657676576865769657706577165772657736577465775657766577765778657796578065781657826578365784657856578665787657886578965790657916579265793657946579565796657976579865799658006580165802658036580465805658066580765808658096581065811658126581365814658156581665817658186581965820658216582265823658246582565826658276582865829658306583165832658336583465835658366583765838658396584065841658426584365844658456584665847658486584965850658516585265853658546585565856658576585865859658606586165862658636586465865658666586765868658696587065871658726587365874658756587665877658786587965880658816588265883658846588565886658876588865889658906589165892658936589465895658966589765898658996590065901659026590365904659056590665907659086590965910659116591265913659146591565916659176591865919659206592165922659236592465925659266592765928659296593065931659326593365934659356593665937659386593965940659416594265943659446594565946659476594865949659506595165952659536595465955659566595765958659596596065961659626596365964659656596665967659686596965970659716597265973659746597565976659776597865979659806598165982659836598465985659866598765988659896599065991659926599365994659956599665997659986599966000660016600266003660046600566006660076600866009660106601166012660136601466015660166601766018660196602066021660226602366024660256602666027660286602966030660316603266033660346603566036660376603866039660406604166042660436604466045660466604766048660496605066051660526605366054660556605666057660586605966060660616606266063660646606566066660676606866069660706607166072660736607466075660766607766078660796608066081660826608366084660856608666087660886608966090660916609266093660946609566096660976609866099661006610166102661036610466105661066610766108661096611066111661126611366114661156611666117661186611966120661216612266123661246612566126661276612866129661306613166132661336613466135661366613766138661396614066141661426614366144661456614666147661486614966150661516615266153661546615566156661576615866159661606616166162661636616466165661666616766168661696617066171661726617366174661756617666177661786617966180661816618266183661846618566186661876618866189661906619166192661936619466195661966619766198661996620066201662026620366204662056620666207662086620966210662116621266213662146621566216662176621866219662206622166222662236622466225662266622766228662296623066231662326623366234662356623666237662386623966240662416624266243662446624566246662476624866249662506625166252662536625466255662566625766258662596626066261662626626366264662656626666267662686626966270662716627266273662746627566276662776627866279662806628166282662836628466285662866628766288662896629066291662926629366294662956629666297662986629966300663016630266303663046630566306663076630866309663106631166312663136631466315663166631766318663196632066321663226632366324663256632666327663286632966330663316633266333663346633566336663376633866339663406634166342663436634466345663466634766348663496635066351663526635366354663556635666357663586635966360663616636266363663646636566366663676636866369663706637166372663736637466375663766637766378663796638066381663826638366384663856638666387663886638966390663916639266393663946639566396663976639866399664006640166402664036640466405664066640766408664096641066411664126641366414664156641666417664186641966420664216642266423664246642566426664276642866429664306643166432664336643466435664366643766438664396644066441664426644366444664456644666447664486644966450664516645266453664546645566456664576645866459664606646166462664636646466465664666646766468664696647066471664726647366474664756647666477664786647966480664816648266483664846648566486664876648866489664906649166492664936649466495664966649766498664996650066501665026650366504665056650666507665086650966510665116651266513665146651566516665176651866519665206652166522665236652466525665266652766528665296653066531665326653366534665356653666537665386653966540665416654266543665446654566546665476654866549665506655166552665536655466555665566655766558665596656066561665626656366564665656656666567665686656966570665716657266573665746657566576665776657866579665806658166582665836658466585665866658766588665896659066591665926659366594665956659666597665986659966600666016660266603666046660566606666076660866609666106661166612666136661466615666166661766618666196662066621666226662366624666256662666627666286662966630666316663266633666346663566636666376663866639666406664166642666436664466645666466664766648666496665066651666526665366654666556665666657666586665966660666616666266663666646666566666666676666866669666706667166672666736667466675666766667766678666796668066681666826668366684666856668666687666886668966690666916669266693666946669566696666976669866699667006670166702667036670466705667066670766708667096671066711667126671366714667156671666717667186671966720667216672266723667246672566726667276672866729667306673166732667336673466735667366673766738667396674066741667426674366744667456674666747667486674966750667516675266753667546675566756667576675866759667606676166762667636676466765667666676766768667696677066771667726677366774667756677666777667786677966780667816678266783667846678566786667876678866789667906679166792667936679466795667966679766798667996680066801668026680366804668056680666807668086680966810668116681266813668146681566816668176681866819668206682166822668236682466825668266682766828668296683066831668326683366834668356683666837668386683966840668416684266843668446684566846668476684866849668506685166852668536685466855668566685766858668596686066861668626686366864668656686666867668686686966870668716687266873668746687566876668776687866879668806688166882668836688466885668866688766888668896689066891668926689366894668956689666897668986689966900669016690266903669046690566906669076690866909669106691166912669136691466915669166691766918669196692066921669226692366924669256692666927669286692966930669316693266933669346693566936669376693866939669406694166942669436694466945669466694766948669496695066951669526695366954669556695666957669586695966960669616696266963669646696566966669676696866969669706697166972669736697466975669766697766978669796698066981669826698366984669856698666987669886698966990669916699266993669946699566996669976699866999670006700167002670036700467005670066700767008670096701067011670126701367014670156701667017670186701967020670216702267023670246702567026670276702867029670306703167032670336703467035670366703767038670396704067041670426704367044670456704667047670486704967050670516705267053670546705567056670576705867059670606706167062670636706467065670666706767068670696707067071670726707367074670756707667077670786707967080670816708267083670846708567086670876708867089670906709167092670936709467095670966709767098670996710067101671026710367104671056710667107671086710967110671116711267113671146711567116671176711867119671206712167122671236712467125671266712767128671296713067131671326713367134671356713667137671386713967140671416714267143671446714567146671476714867149671506715167152671536715467155671566715767158671596716067161671626716367164671656716667167671686716967170671716717267173671746717567176671776717867179671806718167182671836718467185671866718767188671896719067191671926719367194671956719667197671986719967200672016720267203672046720567206672076720867209672106721167212672136721467215672166721767218672196722067221672226722367224672256722667227672286722967230672316723267233672346723567236672376723867239672406724167242672436724467245672466724767248672496725067251672526725367254672556725667257672586725967260672616726267263672646726567266672676726867269672706727167272672736727467275672766727767278672796728067281672826728367284672856728667287672886728967290672916729267293672946729567296672976729867299673006730167302673036730467305673066730767308673096731067311673126731367314673156731667317673186731967320673216732267323673246732567326673276732867329673306733167332673336733467335673366733767338673396734067341673426734367344673456734667347673486734967350673516735267353673546735567356673576735867359673606736167362673636736467365673666736767368673696737067371673726737367374673756737667377673786737967380673816738267383673846738567386673876738867389673906739167392673936739467395673966739767398673996740067401674026740367404674056740667407674086740967410674116741267413674146741567416674176741867419674206742167422674236742467425674266742767428674296743067431674326743367434674356743667437674386743967440674416744267443674446744567446674476744867449674506745167452674536745467455674566745767458674596746067461674626746367464674656746667467674686746967470674716747267473674746747567476674776747867479674806748167482674836748467485674866748767488674896749067491674926749367494674956749667497674986749967500675016750267503675046750567506675076750867509675106751167512675136751467515675166751767518675196752067521675226752367524675256752667527675286752967530675316753267533675346753567536675376753867539675406754167542675436754467545675466754767548675496755067551675526755367554675556755667557675586755967560675616756267563675646756567566675676756867569675706757167572675736757467575675766757767578675796758067581675826758367584675856758667587675886758967590675916759267593675946759567596675976759867599676006760167602676036760467605676066760767608676096761067611676126761367614676156761667617676186761967620676216762267623676246762567626676276762867629676306763167632676336763467635676366763767638676396764067641676426764367644676456764667647676486764967650676516765267653676546765567656676576765867659676606766167662676636766467665676666766767668676696767067671676726767367674676756767667677676786767967680676816768267683676846768567686676876768867689676906769167692676936769467695676966769767698676996770067701677026770367704677056770667707677086770967710677116771267713677146771567716677176771867719677206772167722677236772467725677266772767728677296773067731677326773367734677356773667737677386773967740677416774267743677446774567746677476774867749677506775167752677536775467755677566775767758677596776067761677626776367764677656776667767677686776967770677716777267773677746777567776677776777867779677806778167782677836778467785677866778767788677896779067791677926779367794677956779667797677986779967800678016780267803678046780567806678076780867809678106781167812678136781467815678166781767818678196782067821678226782367824678256782667827678286782967830678316783267833678346783567836678376783867839678406784167842678436784467845678466784767848678496785067851678526785367854678556785667857678586785967860678616786267863678646786567866678676786867869678706787167872678736787467875678766787767878678796788067881678826788367884678856788667887678886788967890678916789267893678946789567896678976789867899679006790167902679036790467905679066790767908679096791067911679126791367914679156791667917679186791967920679216792267923679246792567926679276792867929679306793167932679336793467935679366793767938679396794067941679426794367944679456794667947679486794967950679516795267953679546795567956679576795867959679606796167962679636796467965679666796767968679696797067971679726797367974679756797667977679786797967980679816798267983679846798567986679876798867989679906799167992679936799467995679966799767998679996800068001680026800368004680056800668007680086800968010680116801268013680146801568016680176801868019680206802168022680236802468025680266802768028680296803068031680326803368034680356803668037680386803968040680416804268043680446804568046680476804868049680506805168052680536805468055680566805768058680596806068061680626806368064680656806668067680686806968070680716807268073680746807568076680776807868079680806808168082680836808468085680866808768088680896809068091680926809368094680956809668097680986809968100681016810268103681046810568106681076810868109681106811168112681136811468115681166811768118681196812068121681226812368124681256812668127681286812968130681316813268133681346813568136681376813868139681406814168142681436814468145681466814768148681496815068151681526815368154681556815668157681586815968160681616816268163681646816568166681676816868169681706817168172681736817468175681766817768178681796818068181681826818368184681856818668187681886818968190681916819268193681946819568196681976819868199682006820168202682036820468205682066820768208682096821068211682126821368214682156821668217682186821968220682216822268223682246822568226682276822868229682306823168232682336823468235682366823768238682396824068241682426824368244682456824668247682486824968250682516825268253682546825568256682576825868259682606826168262682636826468265682666826768268682696827068271682726827368274682756827668277682786827968280682816828268283682846828568286682876828868289682906829168292682936829468295682966829768298682996830068301683026830368304683056830668307683086830968310683116831268313683146831568316683176831868319683206832168322683236832468325683266832768328683296833068331683326833368334683356833668337683386833968340683416834268343683446834568346683476834868349683506835168352683536835468355683566835768358683596836068361683626836368364683656836668367683686836968370683716837268373683746837568376683776837868379683806838168382683836838468385683866838768388683896839068391683926839368394683956839668397683986839968400684016840268403684046840568406684076840868409684106841168412684136841468415684166841768418684196842068421684226842368424684256842668427684286842968430684316843268433684346843568436684376843868439684406844168442684436844468445684466844768448684496845068451684526845368454684556845668457684586845968460684616846268463684646846568466684676846868469684706847168472684736847468475684766847768478684796848068481684826848368484684856848668487684886848968490684916849268493684946849568496684976849868499685006850168502685036850468505685066850768508685096851068511685126851368514685156851668517685186851968520685216852268523685246852568526685276852868529685306853168532685336853468535685366853768538685396854068541685426854368544685456854668547685486854968550685516855268553685546855568556685576855868559685606856168562685636856468565685666856768568685696857068571685726857368574685756857668577685786857968580685816858268583685846858568586685876858868589685906859168592685936859468595685966859768598685996860068601686026860368604686056860668607686086860968610686116861268613686146861568616686176861868619686206862168622686236862468625686266862768628686296863068631686326863368634686356863668637686386863968640686416864268643686446864568646686476864868649686506865168652686536865468655686566865768658686596866068661686626866368664686656866668667686686866968670686716867268673686746867568676686776867868679686806868168682686836868468685686866868768688686896869068691686926869368694686956869668697686986869968700687016870268703687046870568706687076870868709687106871168712687136871468715687166871768718687196872068721687226872368724687256872668727687286872968730687316873268733687346873568736687376873868739687406874168742687436874468745687466874768748687496875068751687526875368754687556875668757687586875968760687616876268763687646876568766687676876868769687706877168772687736877468775687766877768778687796878068781687826878368784687856878668787687886878968790687916879268793687946879568796687976879868799688006880168802688036880468805688066880768808688096881068811688126881368814688156881668817688186881968820688216882268823688246882568826688276882868829688306883168832688336883468835688366883768838688396884068841688426884368844688456884668847688486884968850688516885268853688546885568856688576885868859688606886168862688636886468865688666886768868688696887068871688726887368874688756887668877688786887968880688816888268883688846888568886688876888868889688906889168892688936889468895688966889768898688996890068901689026890368904689056890668907689086890968910689116891268913689146891568916689176891868919689206892168922689236892468925689266892768928689296893068931689326893368934689356893668937689386893968940689416894268943689446894568946689476894868949689506895168952689536895468955689566895768958689596896068961689626896368964689656896668967689686896968970689716897268973689746897568976689776897868979689806898168982689836898468985689866898768988689896899068991689926899368994689956899668997689986899969000690016900269003690046900569006690076900869009690106901169012690136901469015690166901769018690196902069021690226902369024690256902669027690286902969030690316903269033690346903569036690376903869039690406904169042690436904469045690466904769048690496905069051690526905369054690556905669057690586905969060690616906269063690646906569066690676906869069690706907169072690736907469075690766907769078690796908069081690826908369084690856908669087690886908969090690916909269093690946909569096690976909869099691006910169102691036910469105691066910769108691096911069111691126911369114691156911669117691186911969120691216912269123691246912569126691276912869129691306913169132691336913469135691366913769138691396914069141691426914369144691456914669147691486914969150691516915269153691546915569156691576915869159691606916169162691636916469165691666916769168691696917069171691726917369174691756917669177691786917969180691816918269183691846918569186691876918869189691906919169192691936919469195691966919769198691996920069201692026920369204692056920669207692086920969210692116921269213692146921569216692176921869219692206922169222692236922469225692266922769228692296923069231692326923369234692356923669237692386923969240692416924269243692446924569246692476924869249692506925169252692536925469255692566925769258692596926069261692626926369264692656926669267692686926969270692716927269273692746927569276692776927869279692806928169282692836928469285692866928769288692896929069291692926929369294692956929669297692986929969300693016930269303693046930569306693076930869309693106931169312693136931469315693166931769318693196932069321693226932369324693256932669327693286932969330693316933269333693346933569336693376933869339693406934169342693436934469345693466934769348693496935069351693526935369354693556935669357693586935969360693616936269363693646936569366693676936869369693706937169372693736937469375693766937769378693796938069381693826938369384693856938669387693886938969390693916939269393693946939569396693976939869399694006940169402694036940469405694066940769408694096941069411694126941369414694156941669417694186941969420694216942269423694246942569426694276942869429694306943169432694336943469435694366943769438694396944069441694426944369444694456944669447694486944969450694516945269453694546945569456694576945869459694606946169462694636946469465694666946769468694696947069471694726947369474694756947669477694786947969480694816948269483694846948569486694876948869489694906949169492694936949469495694966949769498694996950069501695026950369504695056950669507695086950969510695116951269513695146951569516695176951869519695206952169522695236952469525695266952769528695296953069531695326953369534695356953669537695386953969540695416954269543695446954569546695476954869549695506955169552695536955469555695566955769558695596956069561695626956369564695656956669567695686956969570695716957269573695746957569576695776957869579695806958169582695836958469585695866958769588695896959069591695926959369594695956959669597695986959969600696016960269603696046960569606696076960869609696106961169612696136961469615696166961769618696196962069621696226962369624696256962669627696286962969630696316963269633696346963569636696376963869639696406964169642696436964469645696466964769648696496965069651696526965369654696556965669657696586965969660696616966269663696646966569666696676966869669696706967169672696736967469675696766967769678696796968069681696826968369684696856968669687696886968969690696916969269693696946969569696696976969869699697006970169702697036970469705697066970769708697096971069711697126971369714697156971669717697186971969720697216972269723697246972569726697276972869729697306973169732697336973469735697366973769738697396974069741697426974369744697456974669747697486974969750697516975269753697546975569756697576975869759697606976169762697636976469765697666976769768697696977069771697726977369774697756977669777697786977969780697816978269783697846978569786697876978869789697906979169792697936979469795697966979769798697996980069801698026980369804698056980669807698086980969810698116981269813698146981569816698176981869819698206982169822698236982469825698266982769828698296983069831698326983369834698356983669837698386983969840698416984269843698446984569846698476984869849698506985169852698536985469855698566985769858698596986069861698626986369864698656986669867698686986969870698716987269873698746987569876698776987869879698806988169882698836988469885698866988769888698896989069891698926989369894698956989669897698986989969900699016990269903699046990569906699076990869909699106991169912699136991469915699166991769918699196992069921699226992369924699256992669927699286992969930699316993269933699346993569936699376993869939699406994169942699436994469945699466994769948699496995069951699526995369954699556995669957699586995969960699616996269963699646996569966699676996869969699706997169972699736997469975699766997769978699796998069981699826998369984699856998669987699886998969990699916999269993699946999569996699976999869999700007000170002700037000470005700067000770008700097001070011700127001370014700157001670017700187001970020700217002270023700247002570026700277002870029700307003170032700337003470035700367003770038700397004070041700427004370044700457004670047700487004970050700517005270053700547005570056700577005870059700607006170062700637006470065700667006770068700697007070071700727007370074700757007670077700787007970080700817008270083700847008570086700877008870089700907009170092700937009470095700967009770098700997010070101701027010370104701057010670107701087010970110701117011270113701147011570116701177011870119701207012170122701237012470125701267012770128701297013070131701327013370134701357013670137701387013970140701417014270143701447014570146701477014870149701507015170152701537015470155701567015770158701597016070161701627016370164701657016670167701687016970170701717017270173701747017570176701777017870179701807018170182701837018470185701867018770188701897019070191701927019370194701957019670197701987019970200702017020270203702047020570206702077020870209702107021170212702137021470215702167021770218702197022070221702227022370224702257022670227702287022970230702317023270233702347023570236702377023870239702407024170242702437024470245702467024770248702497025070251702527025370254702557025670257702587025970260702617026270263702647026570266702677026870269702707027170272702737027470275702767027770278702797028070281702827028370284702857028670287702887028970290702917029270293702947029570296702977029870299703007030170302703037030470305703067030770308703097031070311703127031370314703157031670317703187031970320703217032270323703247032570326703277032870329703307033170332703337033470335703367033770338703397034070341703427034370344703457034670347703487034970350703517035270353703547035570356703577035870359703607036170362703637036470365703667036770368703697037070371703727037370374703757037670377703787037970380703817038270383703847038570386703877038870389703907039170392703937039470395703967039770398703997040070401704027040370404704057040670407704087040970410704117041270413704147041570416704177041870419704207042170422704237042470425704267042770428704297043070431704327043370434704357043670437704387043970440704417044270443704447044570446704477044870449704507045170452704537045470455704567045770458704597046070461704627046370464704657046670467704687046970470704717047270473704747047570476704777047870479704807048170482704837048470485704867048770488704897049070491704927049370494704957049670497704987049970500705017050270503705047050570506705077050870509705107051170512705137051470515705167051770518705197052070521705227052370524705257052670527705287052970530705317053270533705347053570536705377053870539705407054170542705437054470545705467054770548705497055070551705527055370554705557055670557705587055970560705617056270563705647056570566705677056870569705707057170572705737057470575705767057770578705797058070581705827058370584705857058670587705887058970590705917059270593705947059570596705977059870599706007060170602706037060470605706067060770608706097061070611706127061370614706157061670617706187061970620706217062270623706247062570626706277062870629706307063170632706337063470635706367063770638706397064070641706427064370644706457064670647706487064970650706517065270653706547065570656706577065870659706607066170662706637066470665706667066770668706697067070671706727067370674706757067670677706787067970680706817068270683706847068570686706877068870689706907069170692706937069470695706967069770698706997070070701707027070370704707057070670707707087070970710707117071270713707147071570716707177071870719707207072170722707237072470725707267072770728707297073070731707327073370734707357073670737707387073970740707417074270743707447074570746707477074870749707507075170752707537075470755707567075770758707597076070761707627076370764707657076670767707687076970770707717077270773707747077570776707777077870779707807078170782707837078470785707867078770788707897079070791707927079370794707957079670797707987079970800708017080270803708047080570806708077080870809708107081170812708137081470815708167081770818708197082070821708227082370824708257082670827708287082970830708317083270833708347083570836708377083870839708407084170842708437084470845708467084770848708497085070851708527085370854708557085670857708587085970860708617086270863708647086570866708677086870869708707087170872708737087470875708767087770878708797088070881708827088370884708857088670887708887088970890708917089270893708947089570896708977089870899709007090170902709037090470905709067090770908709097091070911709127091370914709157091670917709187091970920709217092270923709247092570926709277092870929709307093170932709337093470935709367093770938709397094070941709427094370944709457094670947709487094970950709517095270953709547095570956709577095870959709607096170962709637096470965709667096770968709697097070971709727097370974709757097670977709787097970980709817098270983709847098570986709877098870989709907099170992709937099470995709967099770998709997100071001710027100371004710057100671007710087100971010710117101271013710147101571016710177101871019710207102171022710237102471025710267102771028710297103071031710327103371034710357103671037710387103971040710417104271043710447104571046710477104871049710507105171052710537105471055710567105771058710597106071061710627106371064710657106671067710687106971070710717107271073710747107571076710777107871079710807108171082710837108471085710867108771088710897109071091710927109371094710957109671097710987109971100711017110271103711047110571106711077110871109711107111171112711137111471115711167111771118711197112071121711227112371124711257112671127711287112971130711317113271133711347113571136711377113871139711407114171142711437114471145711467114771148711497115071151711527115371154711557115671157711587115971160711617116271163711647116571166711677116871169711707117171172711737117471175711767117771178711797118071181711827118371184711857118671187711887118971190711917119271193711947119571196711977119871199712007120171202712037120471205712067120771208712097121071211712127121371214712157121671217712187121971220712217122271223712247122571226712277122871229712307123171232712337123471235712367123771238712397124071241712427124371244712457124671247712487124971250712517125271253712547125571256712577125871259712607126171262712637126471265712667126771268712697127071271712727127371274712757127671277712787127971280712817128271283712847128571286712877128871289712907129171292712937129471295712967129771298712997130071301713027130371304713057130671307713087130971310713117131271313713147131571316713177131871319713207132171322713237132471325713267132771328713297133071331713327133371334713357133671337713387133971340713417134271343713447134571346713477134871349713507135171352713537135471355713567135771358713597136071361713627136371364713657136671367713687136971370713717137271373713747137571376713777137871379713807138171382713837138471385713867138771388713897139071391713927139371394713957139671397713987139971400714017140271403714047140571406714077140871409714107141171412714137141471415714167141771418714197142071421714227142371424714257142671427714287142971430714317143271433714347143571436714377143871439714407144171442714437144471445714467144771448714497145071451714527145371454714557145671457714587145971460714617146271463714647146571466714677146871469714707147171472714737147471475714767147771478714797148071481714827148371484714857148671487714887148971490714917149271493714947149571496714977149871499715007150171502715037150471505715067150771508715097151071511715127151371514715157151671517715187151971520715217152271523715247152571526715277152871529715307153171532715337153471535715367153771538715397154071541715427154371544715457154671547715487154971550715517155271553715547155571556715577155871559715607156171562715637156471565715667156771568715697157071571715727157371574715757157671577715787157971580715817158271583715847158571586715877158871589715907159171592715937159471595715967159771598715997160071601716027160371604716057160671607716087160971610716117161271613716147161571616716177161871619716207162171622716237162471625716267162771628716297163071631716327163371634716357163671637716387163971640716417164271643716447164571646716477164871649716507165171652716537165471655716567165771658716597166071661716627166371664716657166671667716687166971670716717167271673716747167571676716777167871679716807168171682716837168471685716867168771688716897169071691716927169371694716957169671697716987169971700717017170271703717047170571706717077170871709717107171171712717137171471715717167171771718717197172071721717227172371724717257172671727717287172971730717317173271733717347173571736717377173871739717407174171742717437174471745717467174771748717497175071751717527175371754717557175671757717587175971760717617176271763717647176571766717677176871769717707177171772717737177471775717767177771778717797178071781717827178371784717857178671787717887178971790717917179271793717947179571796717977179871799718007180171802718037180471805718067180771808718097181071811718127181371814718157181671817718187181971820718217182271823718247182571826718277182871829718307183171832718337183471835718367183771838718397184071841718427184371844718457184671847718487184971850718517185271853718547185571856718577185871859718607186171862718637186471865718667186771868718697187071871718727187371874718757187671877718787187971880718817188271883718847188571886718877188871889718907189171892718937189471895718967189771898718997190071901719027190371904719057190671907719087190971910719117191271913719147191571916719177191871919719207192171922719237192471925719267192771928719297193071931719327193371934719357193671937719387193971940719417194271943719447194571946719477194871949719507195171952719537195471955719567195771958719597196071961719627196371964719657196671967719687196971970719717197271973719747197571976719777197871979719807198171982719837198471985719867198771988719897199071991719927199371994719957199671997719987199972000720017200272003720047200572006720077200872009720107201172012720137201472015720167201772018720197202072021720227202372024720257202672027720287202972030720317203272033720347203572036720377203872039720407204172042720437204472045720467204772048720497205072051720527205372054720557205672057720587205972060720617206272063720647206572066720677206872069720707207172072720737207472075720767207772078720797208072081720827208372084720857208672087720887208972090720917209272093720947209572096720977209872099721007210172102721037210472105721067210772108721097211072111721127211372114721157211672117721187211972120721217212272123721247212572126721277212872129721307213172132721337213472135721367213772138721397214072141721427214372144721457214672147721487214972150721517215272153721547215572156721577215872159721607216172162721637216472165721667216772168721697217072171721727217372174721757217672177721787217972180721817218272183721847218572186721877218872189721907219172192721937219472195721967219772198721997220072201722027220372204722057220672207722087220972210722117221272213722147221572216722177221872219722207222172222722237222472225722267222772228722297223072231722327223372234722357223672237722387223972240722417224272243722447224572246722477224872249722507225172252722537225472255722567225772258722597226072261722627226372264722657226672267722687226972270722717227272273722747227572276722777227872279722807228172282722837228472285722867228772288722897229072291722927229372294722957229672297722987229972300723017230272303723047230572306723077230872309723107231172312723137231472315723167231772318723197232072321723227232372324723257232672327723287232972330723317233272333723347233572336723377233872339723407234172342723437234472345723467234772348723497235072351723527235372354723557235672357723587235972360723617236272363723647236572366723677236872369723707237172372723737237472375723767237772378723797238072381723827238372384723857238672387723887238972390723917239272393723947239572396723977239872399724007240172402724037240472405724067240772408724097241072411724127241372414724157241672417724187241972420724217242272423724247242572426724277242872429724307243172432724337243472435724367243772438724397244072441724427244372444724457244672447724487244972450724517245272453724547245572456724577245872459724607246172462724637246472465724667246772468724697247072471724727247372474724757247672477724787247972480724817248272483724847248572486724877248872489724907249172492724937249472495724967249772498724997250072501725027250372504725057250672507725087250972510725117251272513725147251572516725177251872519725207252172522725237252472525725267252772528725297253072531725327253372534725357253672537725387253972540725417254272543725447254572546725477254872549725507255172552725537255472555725567255772558725597256072561725627256372564725657256672567725687256972570725717257272573725747257572576725777257872579725807258172582725837258472585725867258772588725897259072591725927259372594725957259672597725987259972600726017260272603726047260572606726077260872609726107261172612726137261472615726167261772618726197262072621726227262372624726257262672627726287262972630726317263272633726347263572636726377263872639726407264172642726437264472645726467264772648726497265072651726527265372654726557265672657726587265972660726617266272663726647266572666726677266872669726707267172672726737267472675726767267772678726797268072681726827268372684726857268672687726887268972690726917269272693726947269572696726977269872699727007270172702727037270472705727067270772708727097271072711727127271372714727157271672717727187271972720727217272272723727247272572726727277272872729727307273172732727337273472735727367273772738727397274072741727427274372744727457274672747727487274972750727517275272753727547275572756727577275872759727607276172762727637276472765727667276772768727697277072771727727277372774727757277672777727787277972780727817278272783727847278572786727877278872789727907279172792727937279472795727967279772798727997280072801728027280372804728057280672807728087280972810728117281272813728147281572816728177281872819728207282172822728237282472825728267282772828728297283072831728327283372834728357283672837728387283972840728417284272843728447284572846728477284872849728507285172852728537285472855728567285772858728597286072861728627286372864728657286672867728687286972870728717287272873728747287572876728777287872879728807288172882728837288472885728867288772888728897289072891728927289372894728957289672897728987289972900729017290272903729047290572906729077290872909729107291172912729137291472915729167291772918729197292072921729227292372924729257292672927729287292972930729317293272933729347293572936729377293872939729407294172942729437294472945729467294772948729497295072951729527295372954729557295672957729587295972960729617296272963729647296572966729677296872969729707297172972729737297472975729767297772978729797298072981729827298372984729857298672987729887298972990729917299272993729947299572996729977299872999730007300173002730037300473005730067300773008730097301073011730127301373014730157301673017730187301973020730217302273023730247302573026730277302873029730307303173032730337303473035730367303773038730397304073041730427304373044730457304673047730487304973050730517305273053730547305573056730577305873059730607306173062730637306473065730667306773068730697307073071730727307373074730757307673077730787307973080730817308273083730847308573086730877308873089730907309173092730937309473095730967309773098730997310073101731027310373104731057310673107731087310973110731117311273113731147311573116731177311873119731207312173122731237312473125731267312773128731297313073131731327313373134731357313673137731387313973140731417314273143731447314573146731477314873149731507315173152731537315473155731567315773158731597316073161731627316373164731657316673167731687316973170731717317273173731747317573176731777317873179731807318173182731837318473185731867318773188731897319073191731927319373194731957319673197731987319973200732017320273203732047320573206732077320873209732107321173212732137321473215732167321773218732197322073221732227322373224732257322673227732287322973230732317323273233732347323573236732377323873239732407324173242732437324473245732467324773248732497325073251732527325373254732557325673257732587325973260732617326273263732647326573266732677326873269732707327173272732737327473275732767327773278732797328073281732827328373284732857328673287732887328973290732917329273293732947329573296732977329873299733007330173302733037330473305733067330773308733097331073311733127331373314733157331673317733187331973320733217332273323733247332573326733277332873329733307333173332733337333473335733367333773338733397334073341733427334373344733457334673347733487334973350733517335273353733547335573356733577335873359733607336173362733637336473365733667336773368733697337073371733727337373374733757337673377733787337973380733817338273383733847338573386733877338873389733907339173392733937339473395733967339773398733997340073401734027340373404734057340673407734087340973410734117341273413734147341573416734177341873419734207342173422734237342473425734267342773428734297343073431734327343373434734357343673437734387343973440734417344273443734447344573446734477344873449734507345173452734537345473455734567345773458734597346073461734627346373464734657346673467734687346973470734717347273473734747347573476734777347873479734807348173482734837348473485734867348773488734897349073491734927349373494734957349673497734987349973500735017350273503735047350573506735077350873509735107351173512735137351473515735167351773518735197352073521735227352373524735257352673527735287352973530735317353273533735347353573536735377353873539735407354173542735437354473545735467354773548735497355073551735527355373554735557355673557735587355973560735617356273563735647356573566735677356873569735707357173572735737357473575735767357773578735797358073581735827358373584735857358673587735887358973590735917359273593735947359573596735977359873599736007360173602736037360473605736067360773608736097361073611736127361373614736157361673617736187361973620736217362273623736247362573626736277362873629736307363173632736337363473635736367363773638736397364073641736427364373644736457364673647736487364973650736517365273653736547365573656736577365873659736607366173662736637366473665736667366773668736697367073671736727367373674736757367673677736787367973680736817368273683736847368573686736877368873689736907369173692736937369473695736967369773698736997370073701737027370373704737057370673707737087370973710737117371273713737147371573716737177371873719737207372173722737237372473725737267372773728737297373073731737327373373734737357373673737737387373973740737417374273743737447374573746737477374873749737507375173752737537375473755737567375773758737597376073761737627376373764737657376673767737687376973770737717377273773737747377573776737777377873779737807378173782737837378473785737867378773788737897379073791737927379373794737957379673797737987379973800738017380273803738047380573806738077380873809738107381173812738137381473815738167381773818738197382073821738227382373824738257382673827738287382973830738317383273833738347383573836738377383873839738407384173842738437384473845738467384773848738497385073851738527385373854738557385673857738587385973860738617386273863738647386573866738677386873869738707387173872738737387473875738767387773878738797388073881738827388373884738857388673887738887388973890738917389273893738947389573896738977389873899739007390173902739037390473905739067390773908739097391073911739127391373914739157391673917739187391973920739217392273923739247392573926739277392873929739307393173932739337393473935739367393773938739397394073941739427394373944739457394673947739487394973950739517395273953739547395573956739577395873959739607396173962739637396473965739667396773968739697397073971739727397373974739757397673977739787397973980739817398273983739847398573986739877398873989739907399173992739937399473995739967399773998739997400074001740027400374004740057400674007740087400974010740117401274013740147401574016740177401874019740207402174022740237402474025740267402774028740297403074031740327403374034740357403674037740387403974040740417404274043740447404574046740477404874049740507405174052740537405474055740567405774058740597406074061740627406374064740657406674067740687406974070740717407274073740747407574076740777407874079740807408174082740837408474085740867408774088740897409074091740927409374094740957409674097740987409974100741017410274103741047410574106741077410874109741107411174112741137411474115741167411774118741197412074121741227412374124741257412674127741287412974130741317413274133741347413574136741377413874139741407414174142741437414474145741467414774148741497415074151741527415374154741557415674157741587415974160741617416274163741647416574166741677416874169741707417174172741737417474175741767417774178741797418074181741827418374184741857418674187741887418974190741917419274193741947419574196741977419874199742007420174202742037420474205742067420774208742097421074211742127421374214742157421674217742187421974220742217422274223742247422574226742277422874229742307423174232742337423474235742367423774238742397424074241742427424374244742457424674247742487424974250742517425274253742547425574256742577425874259742607426174262742637426474265742667426774268742697427074271742727427374274742757427674277742787427974280742817428274283742847428574286742877428874289742907429174292742937429474295742967429774298742997430074301743027430374304743057430674307743087430974310743117431274313743147431574316743177431874319743207432174322743237432474325743267432774328743297433074331743327433374334743357433674337743387433974340743417434274343743447434574346743477434874349743507435174352743537435474355743567435774358743597436074361743627436374364743657436674367743687436974370743717437274373743747437574376743777437874379743807438174382743837438474385743867438774388743897439074391743927439374394743957439674397743987439974400744017440274403744047440574406744077440874409744107441174412744137441474415744167441774418744197442074421744227442374424744257442674427744287442974430744317443274433744347443574436744377443874439744407444174442744437444474445744467444774448744497445074451744527445374454744557445674457744587445974460744617446274463744647446574466744677446874469744707447174472744737447474475744767447774478744797448074481744827448374484744857448674487744887448974490744917449274493744947449574496744977449874499745007450174502745037450474505745067450774508745097451074511745127451374514745157451674517745187451974520745217452274523745247452574526745277452874529745307453174532745337453474535745367453774538745397454074541745427454374544745457454674547745487454974550745517455274553745547455574556745577455874559745607456174562745637456474565745667456774568745697457074571745727457374574745757457674577745787457974580745817458274583745847458574586745877458874589745907459174592745937459474595745967459774598745997460074601746027460374604746057460674607746087460974610746117461274613746147461574616746177461874619746207462174622746237462474625746267462774628746297463074631746327463374634746357463674637746387463974640746417464274643746447464574646746477464874649746507465174652746537465474655746567465774658746597466074661746627466374664746657466674667746687466974670746717467274673746747467574676746777467874679746807468174682746837468474685746867468774688746897469074691746927469374694746957469674697746987469974700747017470274703747047470574706747077470874709747107471174712747137471474715747167471774718747197472074721747227472374724747257472674727747287472974730747317473274733747347473574736747377473874739747407474174742747437474474745747467474774748747497475074751747527475374754747557475674757747587475974760747617476274763747647476574766747677476874769747707477174772747737477474775747767477774778747797478074781747827478374784747857478674787747887478974790747917479274793747947479574796747977479874799748007480174802748037480474805748067480774808748097481074811748127481374814748157481674817748187481974820748217482274823748247482574826748277482874829748307483174832748337483474835748367483774838748397484074841748427484374844748457484674847748487484974850748517485274853748547485574856748577485874859748607486174862748637486474865748667486774868748697487074871748727487374874748757487674877748787487974880748817488274883748847488574886748877488874889748907489174892748937489474895748967489774898748997490074901749027490374904749057490674907749087490974910749117491274913749147491574916749177491874919749207492174922749237492474925749267492774928749297493074931749327493374934749357493674937749387493974940749417494274943749447494574946749477494874949749507495174952749537495474955749567495774958749597496074961749627496374964749657496674967749687496974970749717497274973749747497574976749777497874979749807498174982749837498474985749867498774988749897499074991749927499374994749957499674997749987499975000750017500275003750047500575006750077500875009750107501175012750137501475015750167501775018750197502075021750227502375024750257502675027750287502975030750317503275033750347503575036750377503875039750407504175042750437504475045750467504775048750497505075051750527505375054750557505675057750587505975060750617506275063750647506575066750677506875069750707507175072750737507475075750767507775078750797508075081750827508375084750857508675087750887508975090750917509275093750947509575096750977509875099751007510175102751037510475105751067510775108751097511075111751127511375114751157511675117751187511975120751217512275123751247512575126751277512875129751307513175132751337513475135751367513775138751397514075141751427514375144751457514675147751487514975150751517515275153751547515575156751577515875159751607516175162751637516475165751667516775168751697517075171751727517375174751757517675177751787517975180751817518275183751847518575186751877518875189751907519175192751937519475195751967519775198751997520075201752027520375204752057520675207752087520975210752117521275213752147521575216752177521875219752207522175222752237522475225752267522775228752297523075231752327523375234752357523675237752387523975240752417524275243752447524575246752477524875249752507525175252752537525475255752567525775258752597526075261752627526375264752657526675267752687526975270752717527275273752747527575276752777527875279752807528175282752837528475285752867528775288752897529075291752927529375294752957529675297752987529975300753017530275303753047530575306753077530875309753107531175312753137531475315753167531775318753197532075321753227532375324753257532675327753287532975330753317533275333753347533575336753377533875339753407534175342753437534475345753467534775348753497535075351753527535375354753557535675357753587535975360753617536275363753647536575366753677536875369753707537175372753737537475375753767537775378753797538075381753827538375384753857538675387753887538975390753917539275393753947539575396753977539875399754007540175402754037540475405754067540775408754097541075411754127541375414754157541675417754187541975420754217542275423754247542575426754277542875429754307543175432754337543475435754367543775438754397544075441754427544375444754457544675447754487544975450754517545275453754547545575456754577545875459754607546175462754637546475465754667546775468754697547075471754727547375474754757547675477754787547975480754817548275483754847548575486754877548875489754907549175492754937549475495754967549775498754997550075501755027550375504755057550675507755087550975510755117551275513755147551575516755177551875519755207552175522755237552475525755267552775528755297553075531755327553375534755357553675537755387553975540755417554275543755447554575546755477554875549755507555175552755537555475555755567555775558755597556075561755627556375564755657556675567755687556975570755717557275573755747557575576755777557875579755807558175582755837558475585755867558775588755897559075591755927559375594755957559675597755987559975600756017560275603756047560575606756077560875609756107561175612756137561475615756167561775618756197562075621756227562375624756257562675627756287562975630756317563275633756347563575636756377563875639756407564175642756437564475645756467564775648756497565075651756527565375654756557565675657756587565975660756617566275663756647566575666756677566875669756707567175672756737567475675756767567775678756797568075681756827568375684756857568675687756887568975690756917569275693756947569575696756977569875699757007570175702757037570475705757067570775708757097571075711757127571375714757157571675717757187571975720757217572275723757247572575726757277572875729757307573175732757337573475735757367573775738757397574075741757427574375744757457574675747757487574975750757517575275753757547575575756757577575875759757607576175762757637576475765757667576775768757697577075771757727577375774757757577675777757787577975780757817578275783757847578575786757877578875789757907579175792757937579475795757967579775798757997580075801758027580375804758057580675807758087580975810758117581275813758147581575816758177581875819758207582175822758237582475825758267582775828758297583075831758327583375834758357583675837758387583975840758417584275843758447584575846758477584875849758507585175852758537585475855758567585775858758597586075861758627586375864758657586675867758687586975870758717587275873758747587575876758777587875879758807588175882758837588475885758867588775888758897589075891758927589375894758957589675897758987589975900759017590275903759047590575906759077590875909759107591175912759137591475915759167591775918759197592075921759227592375924759257592675927759287592975930759317593275933759347593575936759377593875939759407594175942759437594475945759467594775948759497595075951759527595375954759557595675957759587595975960759617596275963759647596575966759677596875969759707597175972759737597475975759767597775978759797598075981759827598375984759857598675987759887598975990759917599275993759947599575996759977599875999760007600176002760037600476005760067600776008760097601076011760127601376014760157601676017760187601976020760217602276023760247602576026760277602876029760307603176032760337603476035760367603776038760397604076041760427604376044760457604676047760487604976050760517605276053760547605576056760577605876059760607606176062760637606476065760667606776068760697607076071760727607376074760757607676077760787607976080760817608276083760847608576086760877608876089760907609176092760937609476095760967609776098760997610076101761027610376104761057610676107761087610976110761117611276113761147611576116761177611876119761207612176122761237612476125761267612776128761297613076131761327613376134761357613676137761387613976140761417614276143761447614576146761477614876149761507615176152761537615476155761567615776158761597616076161761627616376164761657616676167761687616976170761717617276173761747617576176761777617876179761807618176182761837618476185761867618776188761897619076191761927619376194761957619676197761987619976200762017620276203762047620576206762077620876209762107621176212762137621476215762167621776218762197622076221762227622376224762257622676227762287622976230762317623276233762347623576236762377623876239762407624176242762437624476245762467624776248762497625076251762527625376254762557625676257762587625976260762617626276263762647626576266762677626876269762707627176272762737627476275762767627776278762797628076281762827628376284762857628676287762887628976290762917629276293762947629576296762977629876299763007630176302763037630476305763067630776308763097631076311763127631376314763157631676317763187631976320763217632276323763247632576326763277632876329763307633176332763337633476335763367633776338763397634076341763427634376344763457634676347763487634976350763517635276353763547635576356763577635876359763607636176362763637636476365763667636776368763697637076371763727637376374763757637676377763787637976380763817638276383763847638576386763877638876389763907639176392763937639476395763967639776398763997640076401764027640376404764057640676407764087640976410764117641276413764147641576416764177641876419764207642176422764237642476425764267642776428764297643076431764327643376434764357643676437764387643976440764417644276443764447644576446764477644876449764507645176452764537645476455764567645776458764597646076461764627646376464764657646676467764687646976470764717647276473764747647576476764777647876479764807648176482764837648476485764867648776488764897649076491764927649376494764957649676497764987649976500765017650276503765047650576506765077650876509765107651176512765137651476515765167651776518765197652076521765227652376524765257652676527765287652976530765317653276533765347653576536765377653876539765407654176542765437654476545765467654776548765497655076551765527655376554765557655676557765587655976560765617656276563765647656576566765677656876569765707657176572765737657476575765767657776578765797658076581765827658376584765857658676587765887658976590765917659276593765947659576596765977659876599766007660176602766037660476605766067660776608766097661076611766127661376614766157661676617766187661976620766217662276623766247662576626766277662876629766307663176632766337663476635766367663776638766397664076641766427664376644766457664676647766487664976650766517665276653766547665576656766577665876659766607666176662766637666476665766667666776668766697667076671766727667376674766757667676677766787667976680766817668276683766847668576686766877668876689766907669176692766937669476695766967669776698766997670076701767027670376704767057670676707767087670976710767117671276713767147671576716767177671876719767207672176722767237672476725767267672776728767297673076731767327673376734767357673676737767387673976740767417674276743767447674576746767477674876749767507675176752767537675476755767567675776758767597676076761767627676376764767657676676767767687676976770767717677276773767747677576776767777677876779767807678176782767837678476785767867678776788767897679076791767927679376794767957679676797767987679976800768017680276803768047680576806768077680876809768107681176812768137681476815768167681776818768197682076821768227682376824768257682676827768287682976830768317683276833768347683576836768377683876839768407684176842768437684476845768467684776848768497685076851768527685376854768557685676857768587685976860768617686276863768647686576866768677686876869768707687176872768737687476875768767687776878768797688076881768827688376884768857688676887768887688976890768917689276893768947689576896768977689876899769007690176902769037690476905769067690776908769097691076911769127691376914769157691676917769187691976920769217692276923769247692576926769277692876929769307693176932769337693476935769367693776938769397694076941769427694376944769457694676947769487694976950769517695276953769547695576956769577695876959769607696176962769637696476965769667696776968769697697076971769727697376974769757697676977769787697976980769817698276983769847698576986769877698876989769907699176992769937699476995769967699776998769997700077001770027700377004770057700677007770087700977010770117701277013770147701577016770177701877019770207702177022770237702477025770267702777028770297703077031770327703377034770357703677037770387703977040770417704277043770447704577046770477704877049770507705177052770537705477055770567705777058770597706077061770627706377064770657706677067770687706977070770717707277073770747707577076770777707877079770807708177082770837708477085770867708777088770897709077091770927709377094770957709677097770987709977100771017710277103771047710577106771077710877109771107711177112771137711477115771167711777118771197712077121771227712377124771257712677127771287712977130771317713277133771347713577136771377713877139771407714177142771437714477145771467714777148771497715077151771527715377154771557715677157771587715977160771617716277163771647716577166771677716877169771707717177172771737717477175771767717777178771797718077181771827718377184771857718677187771887718977190771917719277193771947719577196771977719877199772007720177202772037720477205772067720777208772097721077211772127721377214772157721677217772187721977220772217722277223772247722577226772277722877229772307723177232772337723477235772367723777238772397724077241772427724377244772457724677247772487724977250772517725277253772547725577256772577725877259772607726177262772637726477265772667726777268772697727077271772727727377274772757727677277772787727977280772817728277283772847728577286772877728877289772907729177292772937729477295772967729777298772997730077301773027730377304773057730677307773087730977310773117731277313773147731577316773177731877319773207732177322773237732477325773267732777328773297733077331773327733377334773357733677337773387733977340773417734277343773447734577346773477734877349773507735177352773537735477355773567735777358773597736077361773627736377364773657736677367773687736977370773717737277373773747737577376773777737877379773807738177382773837738477385773867738777388773897739077391773927739377394773957739677397773987739977400774017740277403774047740577406774077740877409774107741177412774137741477415774167741777418774197742077421774227742377424774257742677427774287742977430774317743277433774347743577436774377743877439774407744177442774437744477445774467744777448774497745077451774527745377454774557745677457774587745977460774617746277463774647746577466774677746877469774707747177472774737747477475774767747777478774797748077481774827748377484774857748677487774887748977490774917749277493774947749577496774977749877499775007750177502775037750477505775067750777508775097751077511775127751377514775157751677517775187751977520775217752277523775247752577526775277752877529775307753177532775337753477535775367753777538775397754077541775427754377544775457754677547775487754977550775517755277553775547755577556775577755877559775607756177562775637756477565775667756777568775697757077571775727757377574775757757677577775787757977580775817758277583775847758577586775877758877589775907759177592775937759477595775967759777598775997760077601776027760377604776057760677607776087760977610776117761277613776147761577616776177761877619776207762177622776237762477625776267762777628776297763077631776327763377634776357763677637776387763977640776417764277643776447764577646776477764877649776507765177652776537765477655776567765777658776597766077661776627766377664776657766677667776687766977670776717767277673776747767577676776777767877679776807768177682776837768477685776867768777688776897769077691776927769377694776957769677697776987769977700777017770277703777047770577706777077770877709777107771177712777137771477715777167771777718777197772077721777227772377724777257772677727777287772977730777317773277733777347773577736777377773877739777407774177742777437774477745777467774777748777497775077751777527775377754777557775677757777587775977760777617776277763777647776577766777677776877769777707777177772777737777477775777767777777778777797778077781777827778377784777857778677787777887778977790777917779277793777947779577796777977779877799778007780177802778037780477805778067780777808778097781077811778127781377814778157781677817778187781977820778217782277823778247782577826778277782877829778307783177832778337783477835778367783777838778397784077841778427784377844778457784677847778487784977850778517785277853778547785577856778577785877859778607786177862778637786477865778667786777868778697787077871778727787377874778757787677877778787787977880778817788277883778847788577886778877788877889778907789177892778937789477895778967789777898778997790077901779027790377904779057790677907779087790977910779117791277913779147791577916779177791877919779207792177922779237792477925779267792777928779297793077931779327793377934779357793677937779387793977940779417794277943779447794577946779477794877949779507795177952779537795477955779567795777958779597796077961779627796377964779657796677967779687796977970779717797277973779747797577976779777797877979779807798177982779837798477985779867798777988779897799077991779927799377994779957799677997779987799978000780017800278003780047800578006780077800878009780107801178012780137801478015780167801778018780197802078021780227802378024780257802678027780287802978030780317803278033780347803578036780377803878039780407804178042780437804478045780467804778048780497805078051780527805378054780557805678057780587805978060780617806278063780647806578066780677806878069780707807178072780737807478075780767807778078780797808078081780827808378084780857808678087780887808978090780917809278093780947809578096780977809878099781007810178102781037810478105781067810778108781097811078111781127811378114781157811678117781187811978120781217812278123781247812578126781277812878129781307813178132781337813478135781367813778138781397814078141781427814378144781457814678147781487814978150781517815278153781547815578156781577815878159781607816178162781637816478165781667816778168781697817078171781727817378174781757817678177781787817978180781817818278183781847818578186781877818878189781907819178192781937819478195781967819778198781997820078201782027820378204782057820678207782087820978210782117821278213782147821578216782177821878219782207822178222782237822478225782267822778228782297823078231782327823378234782357823678237782387823978240782417824278243782447824578246782477824878249782507825178252782537825478255782567825778258782597826078261782627826378264782657826678267782687826978270782717827278273782747827578276782777827878279782807828178282782837828478285782867828778288782897829078291782927829378294782957829678297782987829978300783017830278303783047830578306783077830878309783107831178312783137831478315783167831778318783197832078321783227832378324783257832678327783287832978330783317833278333783347833578336783377833878339783407834178342783437834478345783467834778348783497835078351783527835378354783557835678357783587835978360783617836278363783647836578366783677836878369783707837178372783737837478375783767837778378783797838078381783827838378384783857838678387783887838978390783917839278393783947839578396783977839878399784007840178402784037840478405784067840778408784097841078411784127841378414784157841678417784187841978420784217842278423784247842578426784277842878429784307843178432784337843478435784367843778438784397844078441784427844378444784457844678447784487844978450784517845278453784547845578456784577845878459784607846178462784637846478465784667846778468784697847078471784727847378474784757847678477784787847978480784817848278483784847848578486784877848878489784907849178492784937849478495784967849778498784997850078501785027850378504785057850678507785087850978510785117851278513785147851578516785177851878519785207852178522785237852478525785267852778528785297853078531785327853378534785357853678537785387853978540785417854278543785447854578546785477854878549785507855178552785537855478555785567855778558785597856078561785627856378564785657856678567785687856978570785717857278573785747857578576785777857878579785807858178582785837858478585785867858778588785897859078591785927859378594785957859678597785987859978600786017860278603786047860578606786077860878609786107861178612786137861478615786167861778618786197862078621786227862378624786257862678627786287862978630786317863278633786347863578636786377863878639786407864178642786437864478645786467864778648786497865078651786527865378654786557865678657786587865978660786617866278663786647866578666786677866878669786707867178672786737867478675786767867778678786797868078681786827868378684786857868678687786887868978690786917869278693786947869578696786977869878699787007870178702787037870478705787067870778708787097871078711787127871378714787157871678717787187871978720787217872278723787247872578726787277872878729787307873178732787337873478735787367873778738787397874078741787427874378744787457874678747787487874978750787517875278753787547875578756787577875878759787607876178762787637876478765787667876778768787697877078771787727877378774787757877678777787787877978780787817878278783787847878578786787877878878789787907879178792787937879478795787967879778798787997880078801788027880378804788057880678807788087880978810788117881278813788147881578816788177881878819788207882178822788237882478825788267882778828788297883078831788327883378834788357883678837788387883978840788417884278843788447884578846788477884878849788507885178852788537885478855788567885778858788597886078861788627886378864788657886678867788687886978870788717887278873788747887578876788777887878879788807888178882788837888478885788867888778888788897889078891788927889378894788957889678897788987889978900789017890278903789047890578906789077890878909789107891178912789137891478915789167891778918789197892078921789227892378924789257892678927789287892978930789317893278933789347893578936789377893878939789407894178942789437894478945789467894778948789497895078951789527895378954789557895678957789587895978960789617896278963789647896578966789677896878969789707897178972789737897478975789767897778978789797898078981789827898378984789857898678987789887898978990789917899278993789947899578996789977899878999790007900179002790037900479005790067900779008790097901079011790127901379014790157901679017790187901979020790217902279023790247902579026790277902879029790307903179032790337903479035790367903779038790397904079041790427904379044790457904679047790487904979050790517905279053790547905579056790577905879059790607906179062790637906479065790667906779068790697907079071790727907379074790757907679077790787907979080790817908279083790847908579086790877908879089790907909179092790937909479095790967909779098790997910079101791027910379104791057910679107791087910979110791117911279113791147911579116791177911879119791207912179122791237912479125791267912779128791297913079131791327913379134791357913679137791387913979140791417914279143791447914579146791477914879149791507915179152791537915479155791567915779158791597916079161791627916379164791657916679167791687916979170791717917279173791747917579176791777917879179791807918179182791837918479185791867918779188791897919079191791927919379194791957919679197791987919979200792017920279203792047920579206792077920879209792107921179212792137921479215792167921779218792197922079221792227922379224792257922679227792287922979230792317923279233792347923579236792377923879239792407924179242792437924479245792467924779248792497925079251792527925379254792557925679257792587925979260792617926279263792647926579266792677926879269792707927179272792737927479275792767927779278792797928079281792827928379284792857928679287792887928979290792917929279293792947929579296792977929879299793007930179302793037930479305793067930779308793097931079311793127931379314793157931679317793187931979320793217932279323793247932579326793277932879329793307933179332793337933479335793367933779338793397934079341793427934379344793457934679347793487934979350793517935279353793547935579356793577935879359793607936179362793637936479365793667936779368793697937079371793727937379374793757937679377793787937979380793817938279383793847938579386793877938879389793907939179392793937939479395793967939779398793997940079401794027940379404794057940679407794087940979410794117941279413794147941579416794177941879419794207942179422794237942479425794267942779428794297943079431794327943379434794357943679437794387943979440794417944279443794447944579446794477944879449794507945179452794537945479455794567945779458794597946079461794627946379464794657946679467794687946979470794717947279473794747947579476794777947879479794807948179482794837948479485794867948779488794897949079491794927949379494794957949679497794987949979500795017950279503795047950579506795077950879509795107951179512795137951479515795167951779518795197952079521795227952379524795257952679527795287952979530795317953279533795347953579536795377953879539795407954179542795437954479545795467954779548795497955079551795527955379554795557955679557795587955979560795617956279563795647956579566795677956879569795707957179572795737957479575795767957779578795797958079581795827958379584795857958679587795887958979590795917959279593795947959579596795977959879599796007960179602796037960479605796067960779608796097961079611796127961379614796157961679617796187961979620796217962279623796247962579626796277962879629796307963179632796337963479635796367963779638796397964079641796427964379644796457964679647796487964979650796517965279653796547965579656796577965879659796607966179662796637966479665796667966779668796697967079671796727967379674796757967679677796787967979680796817968279683796847968579686796877968879689796907969179692796937969479695796967969779698796997970079701797027970379704797057970679707797087970979710797117971279713797147971579716797177971879719797207972179722797237972479725797267972779728797297973079731797327973379734797357973679737797387973979740797417974279743797447974579746797477974879749797507975179752797537975479755797567975779758797597976079761797627976379764797657976679767797687976979770797717977279773797747977579776797777977879779797807978179782797837978479785797867978779788797897979079791797927979379794797957979679797797987979979800798017980279803798047980579806798077980879809798107981179812798137981479815798167981779818798197982079821798227982379824798257982679827798287982979830798317983279833798347983579836798377983879839798407984179842798437984479845798467984779848798497985079851798527985379854798557985679857798587985979860798617986279863798647986579866798677986879869798707987179872798737987479875798767987779878798797988079881798827988379884798857988679887798887988979890798917989279893798947989579896798977989879899799007990179902799037990479905799067990779908799097991079911799127991379914799157991679917799187991979920799217992279923799247992579926799277992879929799307993179932799337993479935799367993779938799397994079941799427994379944799457994679947799487994979950799517995279953799547995579956799577995879959799607996179962799637996479965799667996779968799697997079971799727997379974799757997679977799787997979980799817998279983799847998579986799877998879989799907999179992799937999479995799967999779998799998000080001800028000380004800058000680007800088000980010800118001280013800148001580016800178001880019800208002180022800238002480025800268002780028800298003080031800328003380034800358003680037800388003980040800418004280043800448004580046800478004880049800508005180052800538005480055800568005780058800598006080061800628006380064800658006680067800688006980070800718007280073800748007580076800778007880079800808008180082800838008480085800868008780088800898009080091800928009380094800958009680097800988009980100801018010280103801048010580106801078010880109801108011180112801138011480115801168011780118801198012080121801228012380124801258012680127801288012980130801318013280133801348013580136801378013880139801408014180142801438014480145801468014780148801498015080151801528015380154801558015680157801588015980160801618016280163801648016580166801678016880169801708017180172801738017480175801768017780178801798018080181801828018380184801858018680187801888018980190801918019280193801948019580196801978019880199802008020180202802038020480205802068020780208802098021080211802128021380214802158021680217802188021980220802218022280223802248022580226802278022880229802308023180232802338023480235802368023780238802398024080241802428024380244802458024680247802488024980250802518025280253802548025580256802578025880259802608026180262802638026480265802668026780268802698027080271802728027380274802758027680277802788027980280802818028280283802848028580286802878028880289802908029180292802938029480295802968029780298802998030080301803028030380304803058030680307803088030980310803118031280313803148031580316803178031880319803208032180322803238032480325803268032780328803298033080331803328033380334803358033680337803388033980340803418034280343803448034580346803478034880349803508035180352803538035480355803568035780358803598036080361803628036380364803658036680367803688036980370803718037280373803748037580376803778037880379803808038180382803838038480385803868038780388803898039080391803928039380394803958039680397803988039980400804018040280403804048040580406804078040880409804108041180412804138041480415804168041780418804198042080421804228042380424804258042680427804288042980430804318043280433804348043580436804378043880439804408044180442804438044480445804468044780448804498045080451804528045380454804558045680457804588045980460804618046280463804648046580466804678046880469804708047180472804738047480475804768047780478804798048080481804828048380484804858048680487804888048980490804918049280493804948049580496804978049880499805008050180502805038050480505805068050780508805098051080511805128051380514805158051680517805188051980520805218052280523805248052580526805278052880529805308053180532805338053480535805368053780538805398054080541805428054380544805458054680547805488054980550805518055280553805548055580556805578055880559805608056180562805638056480565805668056780568805698057080571805728057380574805758057680577805788057980580805818058280583805848058580586805878058880589805908059180592805938059480595805968059780598805998060080601806028060380604806058060680607806088060980610806118061280613806148061580616806178061880619806208062180622806238062480625806268062780628806298063080631806328063380634806358063680637806388063980640806418064280643806448064580646806478064880649806508065180652806538065480655806568065780658806598066080661806628066380664806658066680667806688066980670806718067280673806748067580676806778067880679806808068180682806838068480685806868068780688806898069080691806928069380694806958069680697806988069980700807018070280703807048070580706807078070880709807108071180712807138071480715807168071780718807198072080721807228072380724807258072680727807288072980730807318073280733807348073580736807378073880739807408074180742807438074480745807468074780748807498075080751807528075380754807558075680757807588075980760807618076280763807648076580766807678076880769807708077180772807738077480775807768077780778807798078080781807828078380784807858078680787807888078980790807918079280793807948079580796807978079880799808008080180802808038080480805808068080780808808098081080811808128081380814808158081680817808188081980820808218082280823808248082580826808278082880829808308083180832808338083480835808368083780838808398084080841808428084380844808458084680847808488084980850808518085280853808548085580856808578085880859808608086180862808638086480865808668086780868808698087080871808728087380874808758087680877808788087980880808818088280883808848088580886808878088880889808908089180892808938089480895808968089780898808998090080901809028090380904809058090680907809088090980910809118091280913809148091580916809178091880919809208092180922809238092480925809268092780928809298093080931809328093380934809358093680937809388093980940809418094280943809448094580946809478094880949809508095180952809538095480955809568095780958809598096080961809628096380964809658096680967809688096980970809718097280973809748097580976809778097880979809808098180982809838098480985809868098780988809898099080991809928099380994809958099680997809988099981000810018100281003810048100581006810078100881009810108101181012810138101481015810168101781018810198102081021810228102381024810258102681027810288102981030810318103281033810348103581036810378103881039810408104181042810438104481045810468104781048810498105081051810528105381054810558105681057810588105981060810618106281063810648106581066810678106881069810708107181072810738107481075810768107781078810798108081081810828108381084810858108681087810888108981090810918109281093810948109581096810978109881099811008110181102811038110481105811068110781108811098111081111811128111381114811158111681117811188111981120811218112281123811248112581126811278112881129811308113181132811338113481135811368113781138811398114081141811428114381144811458114681147811488114981150811518115281153811548115581156811578115881159811608116181162811638116481165811668116781168811698117081171811728117381174811758117681177811788117981180811818118281183811848118581186811878118881189811908119181192811938119481195811968119781198811998120081201812028120381204812058120681207812088120981210812118121281213812148121581216812178121881219812208122181222812238122481225812268122781228812298123081231812328123381234812358123681237812388123981240812418124281243812448124581246812478124881249812508125181252812538125481255812568125781258812598126081261812628126381264812658126681267812688126981270812718127281273812748127581276812778127881279812808128181282812838128481285812868128781288812898129081291812928129381294812958129681297812988129981300813018130281303813048130581306813078130881309813108131181312813138131481315813168131781318813198132081321813228132381324813258132681327813288132981330813318133281333813348133581336813378133881339813408134181342813438134481345813468134781348813498135081351813528135381354813558135681357813588135981360813618136281363813648136581366813678136881369813708137181372813738137481375813768137781378813798138081381813828138381384813858138681387813888138981390813918139281393813948139581396813978139881399814008140181402814038140481405814068140781408814098141081411814128141381414814158141681417814188141981420814218142281423814248142581426814278142881429814308143181432814338143481435814368143781438814398144081441814428144381444814458144681447814488144981450814518145281453814548145581456814578145881459814608146181462814638146481465814668146781468814698147081471814728147381474814758147681477814788147981480814818148281483814848148581486814878148881489814908149181492814938149481495814968149781498814998150081501815028150381504815058150681507815088150981510815118151281513815148151581516815178151881519815208152181522815238152481525815268152781528815298153081531815328153381534815358153681537815388153981540815418154281543815448154581546815478154881549815508155181552815538155481555815568155781558815598156081561815628156381564815658156681567815688156981570815718157281573815748157581576815778157881579815808158181582815838158481585815868158781588815898159081591815928159381594815958159681597815988159981600816018160281603816048160581606816078160881609816108161181612816138161481615816168161781618816198162081621816228162381624816258162681627816288162981630816318163281633816348163581636816378163881639816408164181642816438164481645816468164781648816498165081651816528165381654816558165681657816588165981660816618166281663816648166581666816678166881669816708167181672816738167481675816768167781678816798168081681816828168381684816858168681687816888168981690816918169281693816948169581696816978169881699817008170181702817038170481705817068170781708817098171081711817128171381714817158171681717817188171981720817218172281723817248172581726817278172881729817308173181732817338173481735817368173781738817398174081741817428174381744817458174681747817488174981750817518175281753817548175581756817578175881759817608176181762817638176481765817668176781768817698177081771817728177381774817758177681777817788177981780817818178281783817848178581786817878178881789817908179181792817938179481795817968179781798817998180081801818028180381804818058180681807818088180981810818118181281813818148181581816818178181881819818208182181822818238182481825818268182781828818298183081831818328183381834818358183681837818388183981840818418184281843818448184581846818478184881849818508185181852818538185481855818568185781858818598186081861818628186381864818658186681867818688186981870818718187281873818748187581876818778187881879818808188181882818838188481885818868188781888818898189081891818928189381894818958189681897818988189981900819018190281903819048190581906819078190881909819108191181912819138191481915819168191781918819198192081921819228192381924819258192681927819288192981930819318193281933819348193581936819378193881939819408194181942819438194481945819468194781948819498195081951819528195381954819558195681957819588195981960819618196281963819648196581966819678196881969819708197181972819738197481975819768197781978819798198081981819828198381984819858198681987819888198981990819918199281993819948199581996819978199881999820008200182002820038200482005820068200782008820098201082011820128201382014820158201682017820188201982020820218202282023820248202582026820278202882029820308203182032820338203482035820368203782038820398204082041820428204382044820458204682047820488204982050820518205282053820548205582056820578205882059820608206182062820638206482065820668206782068820698207082071820728207382074820758207682077820788207982080820818208282083820848208582086820878208882089820908209182092820938209482095820968209782098820998210082101821028210382104821058210682107821088210982110821118211282113821148211582116821178211882119821208212182122821238212482125821268212782128821298213082131821328213382134821358213682137821388213982140821418214282143821448214582146821478214882149821508215182152821538215482155821568215782158821598216082161821628216382164821658216682167821688216982170821718217282173821748217582176821778217882179821808218182182821838218482185821868218782188821898219082191821928219382194821958219682197821988219982200822018220282203822048220582206822078220882209822108221182212822138221482215822168221782218822198222082221822228222382224822258222682227822288222982230822318223282233822348223582236822378223882239822408224182242822438224482245822468224782248822498225082251822528225382254822558225682257822588225982260822618226282263822648226582266822678226882269822708227182272822738227482275822768227782278822798228082281822828228382284822858228682287822888228982290822918229282293822948229582296822978229882299823008230182302823038230482305823068230782308823098231082311823128231382314823158231682317823188231982320823218232282323823248232582326823278232882329823308233182332823338233482335823368233782338823398234082341823428234382344823458234682347823488234982350823518235282353823548235582356823578235882359823608236182362823638236482365823668236782368823698237082371823728237382374823758237682377823788237982380823818238282383823848238582386823878238882389823908239182392823938239482395823968239782398823998240082401824028240382404824058240682407824088240982410824118241282413824148241582416824178241882419824208242182422824238242482425824268242782428824298243082431824328243382434824358243682437824388243982440824418244282443824448244582446824478244882449824508245182452824538245482455824568245782458824598246082461824628246382464824658246682467824688246982470824718247282473824748247582476824778247882479824808248182482824838248482485824868248782488824898249082491824928249382494824958249682497824988249982500825018250282503825048250582506825078250882509825108251182512825138251482515825168251782518825198252082521825228252382524825258252682527825288252982530825318253282533825348253582536825378253882539825408254182542825438254482545825468254782548825498255082551825528255382554825558255682557825588255982560825618256282563825648256582566825678256882569825708257182572825738257482575825768257782578825798258082581825828258382584825858258682587825888258982590825918259282593825948259582596825978259882599826008260182602826038260482605826068260782608826098261082611826128261382614826158261682617826188261982620826218262282623826248262582626826278262882629826308263182632826338263482635826368263782638826398264082641826428264382644826458264682647826488264982650826518265282653826548265582656826578265882659826608266182662826638266482665826668266782668826698267082671826728267382674826758267682677826788267982680826818268282683826848268582686826878268882689826908269182692826938269482695826968269782698826998270082701827028270382704827058270682707827088270982710827118271282713827148271582716827178271882719827208272182722827238272482725827268272782728827298273082731827328273382734827358273682737827388273982740827418274282743827448274582746827478274882749827508275182752827538275482755827568275782758827598276082761827628276382764827658276682767827688276982770827718277282773827748277582776827778277882779827808278182782827838278482785827868278782788827898279082791827928279382794827958279682797827988279982800828018280282803828048280582806828078280882809828108281182812828138281482815828168281782818828198282082821828228282382824828258282682827828288282982830828318283282833828348283582836828378283882839828408284182842828438284482845828468284782848828498285082851828528285382854828558285682857828588285982860828618286282863828648286582866828678286882869828708287182872828738287482875828768287782878828798288082881828828288382884828858288682887828888288982890828918289282893828948289582896828978289882899829008290182902829038290482905829068290782908829098291082911829128291382914829158291682917829188291982920829218292282923829248292582926829278292882929829308293182932829338293482935829368293782938829398294082941829428294382944829458294682947829488294982950829518295282953829548295582956829578295882959829608296182962829638296482965829668296782968829698297082971829728297382974829758297682977829788297982980829818298282983829848298582986829878298882989829908299182992829938299482995829968299782998829998300083001830028300383004830058300683007830088300983010830118301283013830148301583016830178301883019830208302183022830238302483025830268302783028830298303083031830328303383034830358303683037830388303983040830418304283043830448304583046830478304883049830508305183052830538305483055830568305783058830598306083061830628306383064830658306683067830688306983070830718307283073830748307583076830778307883079830808308183082830838308483085830868308783088830898309083091830928309383094830958309683097830988309983100831018310283103831048310583106831078310883109831108311183112831138311483115831168311783118831198312083121831228312383124831258312683127831288312983130831318313283133831348313583136831378313883139831408314183142831438314483145831468314783148831498315083151831528315383154831558315683157831588315983160831618316283163831648316583166831678316883169831708317183172831738317483175831768317783178831798318083181831828318383184831858318683187831888318983190831918319283193831948319583196831978319883199832008320183202832038320483205832068320783208832098321083211832128321383214832158321683217832188321983220832218322283223832248322583226832278322883229832308323183232832338323483235832368323783238832398324083241832428324383244832458324683247832488324983250832518325283253832548325583256832578325883259832608326183262832638326483265832668326783268832698327083271832728327383274832758327683277832788327983280832818328283283832848328583286832878328883289832908329183292832938329483295832968329783298832998330083301833028330383304833058330683307833088330983310833118331283313833148331583316833178331883319833208332183322833238332483325833268332783328833298333083331833328333383334833358333683337833388333983340833418334283343833448334583346833478334883349833508335183352833538335483355833568335783358833598336083361833628336383364833658336683367833688336983370833718337283373833748337583376833778337883379833808338183382833838338483385833868338783388833898339083391833928339383394833958339683397833988339983400834018340283403834048340583406834078340883409834108341183412834138341483415834168341783418834198342083421834228342383424834258342683427834288342983430834318343283433834348343583436834378343883439834408344183442834438344483445834468344783448834498345083451834528345383454834558345683457834588345983460834618346283463834648346583466834678346883469834708347183472834738347483475834768347783478834798348083481834828348383484834858348683487834888348983490834918349283493834948349583496834978349883499835008350183502835038350483505835068350783508835098351083511835128351383514835158351683517835188351983520835218352283523835248352583526835278352883529835308353183532835338353483535835368353783538835398354083541835428354383544835458354683547835488354983550835518355283553835548355583556835578355883559835608356183562835638356483565835668356783568835698357083571835728357383574835758357683577835788357983580835818358283583835848358583586835878358883589835908359183592835938359483595835968359783598835998360083601836028360383604836058360683607836088360983610836118361283613836148361583616836178361883619836208362183622836238362483625836268362783628836298363083631836328363383634836358363683637836388363983640836418364283643836448364583646836478364883649836508365183652836538365483655836568365783658836598366083661836628366383664836658366683667836688366983670836718367283673836748367583676836778367883679836808368183682836838368483685836868368783688836898369083691836928369383694836958369683697836988369983700837018370283703837048370583706837078370883709837108371183712837138371483715837168371783718837198372083721837228372383724837258372683727837288372983730837318373283733837348373583736837378373883739837408374183742837438374483745837468374783748837498375083751837528375383754837558375683757837588375983760837618376283763837648376583766837678376883769837708377183772837738377483775837768377783778837798378083781837828378383784837858378683787837888378983790837918379283793837948379583796837978379883799838008380183802838038380483805838068380783808838098381083811838128381383814838158381683817838188381983820838218382283823838248382583826838278382883829838308383183832838338383483835838368383783838838398384083841838428384383844838458384683847838488384983850838518385283853838548385583856838578385883859838608386183862838638386483865838668386783868838698387083871838728387383874838758387683877838788387983880838818388283883838848388583886838878388883889838908389183892838938389483895838968389783898838998390083901839028390383904839058390683907839088390983910839118391283913839148391583916839178391883919839208392183922839238392483925839268392783928839298393083931839328393383934839358393683937839388393983940839418394283943839448394583946839478394883949839508395183952839538395483955839568395783958839598396083961839628396383964839658396683967839688396983970839718397283973839748397583976839778397883979839808398183982839838398483985839868398783988839898399083991839928399383994839958399683997839988399984000840018400284003840048400584006840078400884009840108401184012840138401484015840168401784018840198402084021840228402384024840258402684027840288402984030840318403284033840348403584036840378403884039840408404184042840438404484045840468404784048840498405084051840528405384054840558405684057840588405984060840618406284063840648406584066840678406884069840708407184072840738407484075840768407784078840798408084081840828408384084840858408684087840888408984090840918409284093840948409584096840978409884099841008410184102841038410484105841068410784108841098411084111841128411384114841158411684117841188411984120841218412284123841248412584126841278412884129841308413184132841338413484135841368413784138841398414084141841428414384144841458414684147841488414984150841518415284153841548415584156841578415884159841608416184162841638416484165841668416784168841698417084171841728417384174841758417684177841788417984180841818418284183841848418584186841878418884189841908419184192841938419484195841968419784198841998420084201842028420384204842058420684207842088420984210842118421284213842148421584216842178421884219842208422184222842238422484225842268422784228842298423084231842328423384234842358423684237842388423984240842418424284243842448424584246842478424884249842508425184252842538425484255842568425784258842598426084261842628426384264842658426684267842688426984270842718427284273842748427584276842778427884279842808428184282842838428484285842868428784288842898429084291842928429384294842958429684297842988429984300843018430284303843048430584306843078430884309843108431184312843138431484315843168431784318843198432084321843228432384324843258432684327843288432984330843318433284333843348433584336843378433884339843408434184342843438434484345843468434784348843498435084351843528435384354843558435684357843588435984360843618436284363843648436584366843678436884369843708437184372843738437484375843768437784378843798438084381843828438384384843858438684387843888438984390843918439284393843948439584396843978439884399844008440184402844038440484405844068440784408844098441084411844128441384414844158441684417844188441984420844218442284423844248442584426844278442884429844308443184432844338443484435844368443784438844398444084441844428444384444844458444684447844488444984450844518445284453844548445584456844578445884459844608446184462844638446484465844668446784468844698447084471844728447384474844758447684477844788447984480844818448284483844848448584486844878448884489844908449184492844938449484495844968449784498844998450084501845028450384504845058450684507845088450984510845118451284513845148451584516845178451884519845208452184522845238452484525845268452784528845298453084531845328453384534845358453684537845388453984540845418454284543845448454584546845478454884549845508455184552845538455484555845568455784558845598456084561845628456384564845658456684567845688456984570845718457284573845748457584576845778457884579845808458184582845838458484585845868458784588845898459084591845928459384594845958459684597845988459984600846018460284603846048460584606846078460884609846108461184612846138461484615846168461784618846198462084621846228462384624846258462684627846288462984630846318463284633846348463584636846378463884639846408464184642846438464484645846468464784648846498465084651846528465384654846558465684657846588465984660846618466284663846648466584666846678466884669846708467184672846738467484675846768467784678846798468084681846828468384684846858468684687846888468984690846918469284693846948469584696846978469884699847008470184702847038470484705847068470784708847098471084711847128471384714847158471684717847188471984720847218472284723847248472584726847278472884729847308473184732847338473484735847368473784738847398474084741847428474384744847458474684747847488474984750847518475284753847548475584756847578475884759847608476184762847638476484765847668476784768847698477084771847728477384774847758477684777847788477984780847818478284783847848478584786847878478884789847908479184792847938479484795847968479784798847998480084801848028480384804848058480684807848088480984810848118481284813848148481584816848178481884819848208482184822848238482484825848268482784828848298483084831848328483384834848358483684837848388483984840848418484284843848448484584846848478484884849848508485184852848538485484855848568485784858848598486084861848628486384864848658486684867848688486984870848718487284873848748487584876848778487884879848808488184882848838488484885848868488784888848898489084891848928489384894848958489684897848988489984900849018490284903849048490584906849078490884909849108491184912849138491484915849168491784918849198492084921849228492384924849258492684927849288492984930849318493284933849348493584936849378493884939849408494184942849438494484945849468494784948849498495084951849528495384954849558495684957849588495984960849618496284963849648496584966849678496884969849708497184972849738497484975849768497784978849798498084981849828498384984849858498684987849888498984990849918499284993849948499584996849978499884999850008500185002850038500485005850068500785008850098501085011850128501385014850158501685017850188501985020850218502285023850248502585026850278502885029850308503185032850338503485035850368503785038850398504085041850428504385044850458504685047850488504985050850518505285053850548505585056850578505885059850608506185062850638506485065850668506785068850698507085071850728507385074850758507685077850788507985080850818508285083850848508585086850878508885089850908509185092850938509485095850968509785098850998510085101851028510385104851058510685107851088510985110851118511285113851148511585116851178511885119851208512185122851238512485125851268512785128851298513085131851328513385134851358513685137851388513985140851418514285143851448514585146851478514885149851508515185152851538515485155851568515785158851598516085161851628516385164851658516685167851688516985170851718517285173851748517585176851778517885179851808518185182851838518485185851868518785188851898519085191851928519385194851958519685197851988519985200852018520285203852048520585206852078520885209852108521185212852138521485215852168521785218852198522085221852228522385224852258522685227852288522985230852318523285233852348523585236852378523885239852408524185242852438524485245852468524785248852498525085251852528525385254852558525685257852588525985260852618526285263852648526585266852678526885269852708527185272852738527485275852768527785278852798528085281852828528385284852858528685287852888528985290852918529285293852948529585296852978529885299853008530185302853038530485305853068530785308853098531085311853128531385314853158531685317853188531985320853218532285323853248532585326853278532885329853308533185332853338533485335853368533785338853398534085341853428534385344853458534685347853488534985350853518535285353853548535585356853578535885359853608536185362853638536485365853668536785368853698537085371853728537385374853758537685377853788537985380853818538285383853848538585386853878538885389853908539185392853938539485395853968539785398853998540085401854028540385404854058540685407854088540985410854118541285413854148541585416854178541885419854208542185422854238542485425854268542785428854298543085431854328543385434854358543685437854388543985440854418544285443854448544585446854478544885449854508545185452854538545485455854568545785458854598546085461854628546385464854658546685467854688546985470854718547285473854748547585476854778547885479854808548185482854838548485485854868548785488854898549085491854928549385494854958549685497854988549985500855018550285503855048550585506855078550885509855108551185512855138551485515855168551785518855198552085521855228552385524855258552685527855288552985530855318553285533855348553585536855378553885539855408554185542855438554485545855468554785548855498555085551855528555385554855558555685557855588555985560855618556285563855648556585566855678556885569855708557185572855738557485575855768557785578855798558085581855828558385584855858558685587855888558985590855918559285593855948559585596855978559885599856008560185602856038560485605856068560785608856098561085611856128561385614856158561685617856188561985620856218562285623856248562585626856278562885629856308563185632856338563485635856368563785638856398564085641856428564385644856458564685647856488564985650856518565285653856548565585656856578565885659856608566185662856638566485665856668566785668856698567085671856728567385674856758567685677856788567985680856818568285683856848568585686856878568885689856908569185692856938569485695856968569785698856998570085701857028570385704857058570685707857088570985710857118571285713857148571585716857178571885719857208572185722857238572485725857268572785728857298573085731857328573385734857358573685737857388573985740857418574285743857448574585746857478574885749857508575185752857538575485755857568575785758857598576085761857628576385764857658576685767857688576985770857718577285773857748577585776857778577885779857808578185782857838578485785857868578785788857898579085791857928579385794857958579685797857988579985800858018580285803858048580585806858078580885809858108581185812858138581485815858168581785818858198582085821858228582385824858258582685827858288582985830858318583285833858348583585836858378583885839858408584185842858438584485845858468584785848858498585085851858528585385854858558585685857858588585985860858618586285863858648586585866858678586885869858708587185872858738587485875858768587785878858798588085881858828588385884858858588685887858888588985890858918589285893858948589585896858978589885899859008590185902859038590485905859068590785908859098591085911859128591385914859158591685917859188591985920859218592285923859248592585926859278592885929859308593185932859338593485935859368593785938859398594085941859428594385944859458594685947859488594985950859518595285953859548595585956859578595885959859608596185962859638596485965859668596785968859698597085971859728597385974859758597685977859788597985980859818598285983859848598585986859878598885989859908599185992859938599485995859968599785998859998600086001860028600386004860058600686007860088600986010860118601286013860148601586016860178601886019860208602186022860238602486025860268602786028860298603086031860328603386034860358603686037860388603986040860418604286043860448604586046860478604886049860508605186052860538605486055860568605786058860598606086061860628606386064860658606686067860688606986070860718607286073860748607586076860778607886079860808608186082860838608486085860868608786088860898609086091860928609386094860958609686097860988609986100861018610286103861048610586106861078610886109861108611186112861138611486115861168611786118861198612086121861228612386124861258612686127861288612986130861318613286133861348613586136861378613886139861408614186142861438614486145861468614786148861498615086151861528615386154861558615686157861588615986160861618616286163861648616586166861678616886169861708617186172861738617486175861768617786178861798618086181861828618386184861858618686187861888618986190861918619286193861948619586196861978619886199862008620186202862038620486205862068620786208862098621086211862128621386214862158621686217862188621986220862218622286223862248622586226862278622886229862308623186232862338623486235862368623786238862398624086241862428624386244862458624686247862488624986250862518625286253862548625586256862578625886259862608626186262862638626486265862668626786268862698627086271862728627386274862758627686277862788627986280862818628286283862848628586286862878628886289862908629186292862938629486295862968629786298862998630086301863028630386304863058630686307863088630986310863118631286313863148631586316863178631886319863208632186322863238632486325863268632786328863298633086331863328633386334863358633686337863388633986340863418634286343863448634586346863478634886349863508635186352863538635486355863568635786358863598636086361863628636386364863658636686367863688636986370863718637286373863748637586376863778637886379863808638186382863838638486385863868638786388863898639086391863928639386394863958639686397863988639986400864018640286403864048640586406864078640886409864108641186412864138641486415864168641786418864198642086421864228642386424864258642686427864288642986430864318643286433864348643586436864378643886439864408644186442864438644486445864468644786448864498645086451864528645386454864558645686457864588645986460864618646286463864648646586466864678646886469864708647186472864738647486475864768647786478864798648086481864828648386484864858648686487864888648986490864918649286493864948649586496864978649886499865008650186502865038650486505865068650786508865098651086511865128651386514865158651686517865188651986520865218652286523865248652586526865278652886529865308653186532865338653486535865368653786538865398654086541865428654386544865458654686547865488654986550865518655286553865548655586556865578655886559865608656186562865638656486565865668656786568865698657086571865728657386574865758657686577865788657986580865818658286583865848658586586865878658886589865908659186592865938659486595865968659786598865998660086601866028660386604866058660686607866088660986610866118661286613866148661586616866178661886619866208662186622866238662486625866268662786628866298663086631866328663386634866358663686637866388663986640866418664286643866448664586646866478664886649866508665186652866538665486655866568665786658866598666086661866628666386664866658666686667866688666986670866718667286673866748667586676866778667886679866808668186682866838668486685866868668786688866898669086691866928669386694866958669686697866988669986700867018670286703867048670586706867078670886709867108671186712867138671486715867168671786718867198672086721867228672386724867258672686727867288672986730867318673286733867348673586736867378673886739867408674186742867438674486745867468674786748867498675086751867528675386754867558675686757867588675986760867618676286763867648676586766867678676886769867708677186772867738677486775867768677786778867798678086781867828678386784867858678686787867888678986790867918679286793867948679586796867978679886799868008680186802868038680486805868068680786808868098681086811868128681386814868158681686817868188681986820868218682286823868248682586826868278682886829868308683186832868338683486835868368683786838868398684086841868428684386844868458684686847868488684986850868518685286853868548685586856868578685886859868608686186862868638686486865868668686786868868698687086871868728687386874868758687686877868788687986880868818688286883868848688586886868878688886889868908689186892868938689486895868968689786898868998690086901869028690386904869058690686907869088690986910869118691286913869148691586916869178691886919869208692186922869238692486925869268692786928869298693086931869328693386934869358693686937869388693986940869418694286943869448694586946869478694886949869508695186952869538695486955869568695786958869598696086961869628696386964869658696686967869688696986970869718697286973869748697586976869778697886979869808698186982869838698486985869868698786988869898699086991869928699386994869958699686997869988699987000870018700287003870048700587006870078700887009870108701187012870138701487015870168701787018870198702087021870228702387024870258702687027870288702987030870318703287033870348703587036870378703887039870408704187042870438704487045870468704787048870498705087051870528705387054870558705687057870588705987060870618706287063870648706587066870678706887069870708707187072870738707487075870768707787078870798708087081870828708387084870858708687087870888708987090870918709287093870948709587096870978709887099871008710187102871038710487105871068710787108871098711087111871128711387114871158711687117871188711987120871218712287123871248712587126871278712887129871308713187132871338713487135871368713787138871398714087141871428714387144871458714687147871488714987150871518715287153871548715587156871578715887159871608716187162871638716487165871668716787168871698717087171871728717387174871758717687177871788717987180871818718287183871848718587186871878718887189871908719187192871938719487195871968719787198871998720087201872028720387204872058720687207872088720987210872118721287213872148721587216872178721887219872208722187222872238722487225872268722787228872298723087231872328723387234872358723687237872388723987240872418724287243872448724587246872478724887249872508725187252872538725487255872568725787258872598726087261872628726387264872658726687267872688726987270872718727287273872748727587276872778727887279872808728187282872838728487285872868728787288872898729087291872928729387294872958729687297872988729987300873018730287303873048730587306873078730887309873108731187312873138731487315873168731787318873198732087321873228732387324873258732687327873288732987330873318733287333873348733587336873378733887339873408734187342873438734487345873468734787348873498735087351873528735387354873558735687357873588735987360873618736287363873648736587366873678736887369873708737187372873738737487375873768737787378873798738087381873828738387384873858738687387873888738987390873918739287393873948739587396873978739887399874008740187402874038740487405874068740787408874098741087411874128741387414874158741687417874188741987420874218742287423874248742587426874278742887429874308743187432874338743487435874368743787438874398744087441874428744387444874458744687447874488744987450874518745287453874548745587456874578745887459874608746187462874638746487465874668746787468874698747087471874728747387474874758747687477874788747987480874818748287483874848748587486874878748887489874908749187492874938749487495874968749787498874998750087501875028750387504875058750687507875088750987510875118751287513875148751587516875178751887519875208752187522875238752487525875268752787528875298753087531875328753387534875358753687537875388753987540875418754287543875448754587546875478754887549875508755187552875538755487555875568755787558875598756087561875628756387564875658756687567875688756987570875718757287573875748757587576875778757887579875808758187582875838758487585875868758787588875898759087591875928759387594875958759687597875988759987600876018760287603876048760587606876078760887609876108761187612876138761487615876168761787618876198762087621876228762387624876258762687627876288762987630876318763287633876348763587636876378763887639876408764187642876438764487645876468764787648876498765087651876528765387654876558765687657876588765987660876618766287663876648766587666876678766887669876708767187672876738767487675876768767787678876798768087681876828768387684876858768687687876888768987690876918769287693876948769587696876978769887699877008770187702877038770487705877068770787708877098771087711877128771387714877158771687717877188771987720877218772287723877248772587726877278772887729877308773187732877338773487735877368773787738877398774087741877428774387744877458774687747877488774987750877518775287753877548775587756877578775887759877608776187762877638776487765877668776787768877698777087771877728777387774877758777687777877788777987780877818778287783877848778587786877878778887789877908779187792877938779487795877968779787798877998780087801878028780387804878058780687807878088780987810878118781287813878148781587816878178781887819878208782187822878238782487825878268782787828878298783087831878328783387834878358783687837878388783987840878418784287843878448784587846878478784887849878508785187852878538785487855878568785787858878598786087861878628786387864878658786687867878688786987870878718787287873878748787587876878778787887879878808788187882878838788487885878868788787888878898789087891878928789387894878958789687897878988789987900879018790287903879048790587906879078790887909879108791187912879138791487915879168791787918879198792087921879228792387924879258792687927879288792987930879318793287933879348793587936879378793887939879408794187942879438794487945879468794787948879498795087951879528795387954879558795687957879588795987960879618796287963879648796587966879678796887969879708797187972879738797487975879768797787978879798798087981879828798387984879858798687987879888798987990879918799287993879948799587996879978799887999880008800188002880038800488005880068800788008880098801088011880128801388014880158801688017880188801988020880218802288023880248802588026880278802888029880308803188032880338803488035880368803788038880398804088041880428804388044880458804688047880488804988050880518805288053880548805588056880578805888059880608806188062880638806488065880668806788068880698807088071880728807388074880758807688077880788807988080880818808288083880848808588086880878808888089880908809188092880938809488095880968809788098880998810088101881028810388104881058810688107881088810988110881118811288113881148811588116881178811888119881208812188122881238812488125881268812788128881298813088131881328813388134881358813688137881388813988140881418814288143881448814588146881478814888149881508815188152881538815488155881568815788158881598816088161881628816388164881658816688167881688816988170881718817288173881748817588176881778817888179881808818188182881838818488185881868818788188881898819088191881928819388194881958819688197881988819988200882018820288203882048820588206882078820888209882108821188212882138821488215882168821788218882198822088221882228822388224882258822688227882288822988230882318823288233882348823588236882378823888239882408824188242882438824488245882468824788248882498825088251882528825388254882558825688257882588825988260882618826288263882648826588266882678826888269882708827188272882738827488275882768827788278882798828088281882828828388284882858828688287882888828988290882918829288293882948829588296882978829888299883008830188302883038830488305883068830788308883098831088311883128831388314883158831688317883188831988320883218832288323883248832588326883278832888329883308833188332883338833488335883368833788338883398834088341883428834388344883458834688347883488834988350883518835288353883548835588356883578835888359883608836188362883638836488365883668836788368883698837088371883728837388374883758837688377883788837988380883818838288383883848838588386883878838888389883908839188392883938839488395883968839788398883998840088401884028840388404884058840688407884088840988410884118841288413884148841588416884178841888419884208842188422884238842488425884268842788428884298843088431884328843388434884358843688437884388843988440884418844288443884448844588446884478844888449884508845188452884538845488455884568845788458884598846088461884628846388464884658846688467884688846988470884718847288473884748847588476884778847888479884808848188482884838848488485884868848788488884898849088491884928849388494884958849688497884988849988500885018850288503885048850588506885078850888509885108851188512885138851488515885168851788518885198852088521885228852388524885258852688527885288852988530885318853288533885348853588536885378853888539885408854188542885438854488545885468854788548885498855088551885528855388554885558855688557885588855988560885618856288563885648856588566885678856888569885708857188572885738857488575885768857788578885798858088581885828858388584885858858688587885888858988590885918859288593885948859588596885978859888599886008860188602886038860488605886068860788608886098861088611886128861388614886158861688617886188861988620886218862288623886248862588626886278862888629886308863188632886338863488635886368863788638886398864088641886428864388644886458864688647886488864988650886518865288653886548865588656886578865888659886608866188662886638866488665886668866788668886698867088671886728867388674886758867688677886788867988680886818868288683886848868588686886878868888689886908869188692886938869488695886968869788698886998870088701887028870388704887058870688707887088870988710887118871288713887148871588716887178871888719887208872188722887238872488725887268872788728887298873088731887328873388734887358873688737887388873988740887418874288743887448874588746887478874888749887508875188752887538875488755887568875788758887598876088761887628876388764887658876688767887688876988770887718877288773887748877588776887778877888779887808878188782887838878488785887868878788788887898879088791887928879388794887958879688797887988879988800888018880288803888048880588806888078880888809888108881188812888138881488815888168881788818888198882088821888228882388824888258882688827888288882988830888318883288833888348883588836888378883888839888408884188842888438884488845888468884788848888498885088851888528885388854888558885688857888588885988860888618886288863888648886588866888678886888869888708887188872888738887488875888768887788878888798888088881888828888388884888858888688887888888888988890888918889288893888948889588896888978889888899889008890188902889038890488905889068890788908889098891088911889128891388914889158891688917889188891988920889218892288923889248892588926889278892888929889308893188932889338893488935889368893788938889398894088941889428894388944889458894688947889488894988950889518895288953889548895588956889578895888959889608896188962889638896488965889668896788968889698897088971889728897388974889758897688977889788897988980889818898288983889848898588986889878898888989889908899188992889938899488995889968899788998889998900089001890028900389004890058900689007890088900989010890118901289013890148901589016890178901889019890208902189022890238902489025890268902789028890298903089031890328903389034890358903689037890388903989040890418904289043890448904589046890478904889049890508905189052890538905489055890568905789058890598906089061890628906389064890658906689067890688906989070890718907289073890748907589076890778907889079890808908189082890838908489085890868908789088890898909089091890928909389094890958909689097890988909989100891018910289103891048910589106891078910889109891108911189112891138911489115891168911789118891198912089121891228912389124891258912689127891288912989130891318913289133891348913589136891378913889139891408914189142891438914489145891468914789148891498915089151891528915389154891558915689157891588915989160891618916289163891648916589166891678916889169891708917189172891738917489175891768917789178891798918089181891828918389184891858918689187891888918989190891918919289193891948919589196891978919889199892008920189202892038920489205892068920789208892098921089211892128921389214892158921689217892188921989220892218922289223892248922589226892278922889229892308923189232892338923489235892368923789238892398924089241892428924389244892458924689247892488924989250892518925289253892548925589256892578925889259892608926189262892638926489265892668926789268892698927089271892728927389274892758927689277892788927989280892818928289283892848928589286892878928889289892908929189292892938929489295892968929789298892998930089301893028930389304893058930689307893088930989310893118931289313893148931589316893178931889319893208932189322893238932489325893268932789328893298933089331893328933389334893358933689337893388933989340893418934289343893448934589346893478934889349893508935189352893538935489355893568935789358893598936089361893628936389364893658936689367893688936989370893718937289373893748937589376893778937889379893808938189382893838938489385893868938789388893898939089391893928939389394893958939689397893988939989400894018940289403894048940589406894078940889409894108941189412894138941489415894168941789418894198942089421894228942389424894258942689427894288942989430894318943289433894348943589436894378943889439894408944189442894438944489445894468944789448894498945089451894528945389454894558945689457894588945989460894618946289463894648946589466894678946889469894708947189472894738947489475894768947789478894798948089481894828948389484894858948689487894888948989490894918949289493894948949589496894978949889499895008950189502895038950489505895068950789508895098951089511895128951389514895158951689517895188951989520895218952289523895248952589526895278952889529895308953189532895338953489535895368953789538895398954089541895428954389544895458954689547895488954989550895518955289553895548955589556895578955889559895608956189562895638956489565895668956789568895698957089571895728957389574895758957689577895788957989580895818958289583895848958589586895878958889589895908959189592895938959489595895968959789598895998960089601896028960389604896058960689607896088960989610896118961289613896148961589616896178961889619896208962189622896238962489625896268962789628896298963089631896328963389634896358963689637896388963989640896418964289643896448964589646896478964889649896508965189652896538965489655896568965789658896598966089661896628966389664896658966689667896688966989670896718967289673896748967589676896778967889679896808968189682896838968489685896868968789688896898969089691896928969389694896958969689697896988969989700897018970289703897048970589706897078970889709897108971189712897138971489715897168971789718897198972089721897228972389724897258972689727897288972989730897318973289733897348973589736897378973889739897408974189742897438974489745897468974789748897498975089751897528975389754897558975689757897588975989760897618976289763897648976589766897678976889769897708977189772897738977489775897768977789778897798978089781897828978389784897858978689787897888978989790897918979289793897948979589796897978979889799898008980189802898038980489805898068980789808898098981089811898128981389814898158981689817898188981989820898218982289823898248982589826898278982889829898308983189832898338983489835898368983789838898398984089841898428984389844898458984689847898488984989850898518985289853898548985589856898578985889859898608986189862898638986489865898668986789868898698987089871898728987389874898758987689877898788987989880898818988289883898848988589886898878988889889898908989189892898938989489895898968989789898898998990089901899028990389904899058990689907899088990989910899118991289913899148991589916899178991889919899208992189922899238992489925899268992789928899298993089931899328993389934899358993689937899388993989940899418994289943899448994589946899478994889949899508995189952899538995489955899568995789958899598996089961899628996389964899658996689967899688996989970899718997289973899748997589976899778997889979899808998189982899838998489985899868998789988899898999089991899928999389994899958999689997899988999990000900019000290003900049000590006900079000890009900109001190012900139001490015900169001790018900199002090021900229002390024900259002690027900289002990030900319003290033900349003590036900379003890039900409004190042900439004490045900469004790048900499005090051900529005390054900559005690057900589005990060900619006290063900649006590066900679006890069900709007190072900739007490075900769007790078900799008090081900829008390084900859008690087900889008990090900919009290093900949009590096900979009890099901009010190102901039010490105901069010790108901099011090111901129011390114901159011690117901189011990120901219012290123901249012590126901279012890129901309013190132901339013490135901369013790138901399014090141901429014390144901459014690147901489014990150901519015290153901549015590156901579015890159901609016190162901639016490165901669016790168901699017090171901729017390174901759017690177901789017990180901819018290183901849018590186901879018890189901909019190192901939019490195901969019790198901999020090201902029020390204902059020690207902089020990210902119021290213902149021590216902179021890219902209022190222902239022490225902269022790228902299023090231902329023390234902359023690237902389023990240902419024290243902449024590246902479024890249902509025190252902539025490255902569025790258902599026090261902629026390264902659026690267902689026990270902719027290273902749027590276902779027890279902809028190282902839028490285902869028790288902899029090291902929029390294902959029690297902989029990300903019030290303903049030590306903079030890309903109031190312903139031490315903169031790318903199032090321903229032390324903259032690327903289032990330903319033290333903349033590336903379033890339903409034190342903439034490345903469034790348903499035090351903529035390354903559035690357903589035990360903619036290363903649036590366903679036890369903709037190372903739037490375903769037790378903799038090381903829038390384903859038690387903889038990390903919039290393903949039590396903979039890399904009040190402904039040490405904069040790408904099041090411904129041390414904159041690417904189041990420904219042290423904249042590426904279042890429904309043190432904339043490435904369043790438904399044090441904429044390444904459044690447904489044990450904519045290453904549045590456904579045890459904609046190462904639046490465904669046790468904699047090471904729047390474904759047690477904789047990480904819048290483904849048590486904879048890489904909049190492904939049490495904969049790498904999050090501905029050390504905059050690507905089050990510905119051290513905149051590516905179051890519905209052190522905239052490525905269052790528905299053090531905329053390534905359053690537905389053990540905419054290543905449054590546905479054890549905509055190552905539055490555905569055790558905599056090561905629056390564905659056690567905689056990570905719057290573905749057590576905779057890579905809058190582905839058490585905869058790588905899059090591905929059390594905959059690597905989059990600906019060290603906049060590606906079060890609906109061190612906139061490615906169061790618906199062090621906229062390624906259062690627906289062990630906319063290633906349063590636906379063890639906409064190642906439064490645906469064790648906499065090651906529065390654906559065690657906589065990660906619066290663906649066590666906679066890669906709067190672906739067490675906769067790678906799068090681906829068390684906859068690687906889068990690906919069290693906949069590696906979069890699907009070190702907039070490705907069070790708907099071090711907129071390714907159071690717907189071990720907219072290723907249072590726907279072890729907309073190732907339073490735907369073790738907399074090741907429074390744907459074690747907489074990750907519075290753907549075590756907579075890759907609076190762907639076490765907669076790768907699077090771907729077390774907759077690777907789077990780907819078290783907849078590786907879078890789907909079190792907939079490795907969079790798907999080090801908029080390804908059080690807908089080990810908119081290813908149081590816908179081890819908209082190822908239082490825908269082790828908299083090831908329083390834908359083690837908389083990840908419084290843908449084590846908479084890849908509085190852908539085490855908569085790858908599086090861908629086390864908659086690867908689086990870908719087290873908749087590876908779087890879908809088190882908839088490885908869088790888908899089090891908929089390894908959089690897908989089990900909019090290903909049090590906909079090890909909109091190912909139091490915909169091790918909199092090921909229092390924909259092690927909289092990930909319093290933909349093590936909379093890939909409094190942909439094490945909469094790948909499095090951909529095390954909559095690957909589095990960909619096290963909649096590966909679096890969909709097190972909739097490975909769097790978909799098090981909829098390984909859098690987909889098990990909919099290993909949099590996909979099890999910009100191002910039100491005910069100791008910099101091011910129101391014910159101691017910189101991020910219102291023910249102591026910279102891029910309103191032910339103491035910369103791038910399104091041910429104391044910459104691047910489104991050910519105291053910549105591056910579105891059910609106191062910639106491065910669106791068910699107091071910729107391074910759107691077910789107991080910819108291083910849108591086910879108891089910909109191092910939109491095910969109791098910999110091101911029110391104911059110691107911089110991110911119111291113911149111591116911179111891119911209112191122911239112491125911269112791128911299113091131911329113391134911359113691137911389113991140911419114291143911449114591146911479114891149911509115191152911539115491155911569115791158911599116091161911629116391164911659116691167911689116991170911719117291173911749117591176911779117891179911809118191182911839118491185911869118791188911899119091191911929119391194911959119691197911989119991200912019120291203912049120591206912079120891209912109121191212912139121491215912169121791218912199122091221912229122391224912259122691227912289122991230912319123291233912349123591236912379123891239912409124191242912439124491245912469124791248912499125091251912529125391254912559125691257912589125991260912619126291263912649126591266912679126891269912709127191272912739127491275912769127791278912799128091281912829128391284912859128691287912889128991290912919129291293912949129591296912979129891299913009130191302913039130491305913069130791308913099131091311913129131391314913159131691317913189131991320913219132291323913249132591326913279132891329913309133191332913339133491335913369133791338913399134091341913429134391344913459134691347913489134991350913519135291353913549135591356913579135891359913609136191362913639136491365913669136791368913699137091371913729137391374913759137691377913789137991380913819138291383913849138591386913879138891389913909139191392913939139491395913969139791398913999140091401914029140391404914059140691407914089140991410914119141291413914149141591416914179141891419914209142191422914239142491425914269142791428914299143091431914329143391434914359143691437914389143991440914419144291443914449144591446914479144891449914509145191452914539145491455914569145791458914599146091461914629146391464914659146691467914689146991470914719147291473914749147591476914779147891479914809148191482914839148491485914869148791488914899149091491914929149391494914959149691497914989149991500915019150291503915049150591506915079150891509915109151191512915139151491515915169151791518915199152091521915229152391524915259152691527915289152991530915319153291533915349153591536915379153891539915409154191542915439154491545915469154791548915499155091551915529155391554915559155691557915589155991560915619156291563915649156591566915679156891569915709157191572915739157491575915769157791578915799158091581915829158391584915859158691587915889158991590915919159291593915949159591596915979159891599916009160191602916039160491605916069160791608916099161091611916129161391614916159161691617916189161991620916219162291623916249162591626916279162891629916309163191632916339163491635916369163791638916399164091641916429164391644916459164691647916489164991650916519165291653916549165591656916579165891659916609166191662916639166491665916669166791668916699167091671916729167391674916759167691677916789167991680916819168291683916849168591686916879168891689916909169191692916939169491695916969169791698916999170091701917029170391704917059170691707917089170991710917119171291713917149171591716917179171891719917209172191722917239172491725917269172791728917299173091731917329173391734917359173691737917389173991740917419174291743917449174591746917479174891749917509175191752917539175491755917569175791758917599176091761917629176391764917659176691767917689176991770917719177291773917749177591776917779177891779917809178191782917839178491785917869178791788917899179091791917929179391794917959179691797917989179991800918019180291803918049180591806918079180891809918109181191812918139181491815918169181791818918199182091821918229182391824918259182691827918289182991830918319183291833918349183591836918379183891839918409184191842918439184491845918469184791848918499185091851918529185391854918559185691857918589185991860918619186291863918649186591866918679186891869918709187191872918739187491875918769187791878918799188091881918829188391884918859188691887918889188991890918919189291893918949189591896918979189891899919009190191902919039190491905919069190791908919099191091911919129191391914919159191691917919189191991920919219192291923919249192591926919279192891929919309193191932919339193491935919369193791938919399194091941919429194391944919459194691947919489194991950919519195291953919549195591956919579195891959919609196191962919639196491965919669196791968919699197091971919729197391974919759197691977919789197991980919819198291983919849198591986919879198891989919909199191992919939199491995919969199791998919999200092001920029200392004920059200692007920089200992010920119201292013920149201592016920179201892019920209202192022920239202492025920269202792028920299203092031920329203392034920359203692037920389203992040920419204292043920449204592046920479204892049920509205192052920539205492055920569205792058920599206092061920629206392064920659206692067920689206992070920719207292073920749207592076920779207892079920809208192082920839208492085920869208792088920899209092091920929209392094920959209692097920989209992100921019210292103921049210592106921079210892109921109211192112921139211492115921169211792118921199212092121921229212392124921259212692127921289212992130921319213292133921349213592136921379213892139921409214192142921439214492145921469214792148921499215092151921529215392154921559215692157921589215992160921619216292163921649216592166921679216892169921709217192172921739217492175921769217792178921799218092181921829218392184921859218692187921889218992190921919219292193921949219592196921979219892199922009220192202922039220492205922069220792208922099221092211922129221392214922159221692217922189221992220922219222292223922249222592226922279222892229922309223192232922339223492235922369223792238922399224092241922429224392244922459224692247922489224992250922519225292253922549225592256922579225892259922609226192262922639226492265922669226792268922699227092271922729227392274922759227692277922789227992280922819228292283922849228592286922879228892289922909229192292922939229492295922969229792298922999230092301923029230392304923059230692307923089230992310923119231292313923149231592316923179231892319923209232192322923239232492325923269232792328923299233092331923329233392334923359233692337923389233992340923419234292343923449234592346923479234892349923509235192352923539235492355923569235792358923599236092361923629236392364923659236692367923689236992370923719237292373923749237592376923779237892379923809238192382923839238492385923869238792388923899239092391923929239392394923959239692397923989239992400924019240292403924049240592406924079240892409924109241192412924139241492415924169241792418924199242092421924229242392424924259242692427924289242992430924319243292433924349243592436924379243892439924409244192442924439244492445924469244792448924499245092451924529245392454924559245692457924589245992460924619246292463924649246592466924679246892469924709247192472924739247492475924769247792478924799248092481924829248392484924859248692487924889248992490924919249292493924949249592496924979249892499925009250192502925039250492505925069250792508925099251092511925129251392514925159251692517925189251992520925219252292523925249252592526925279252892529925309253192532925339253492535925369253792538925399254092541925429254392544925459254692547925489254992550925519255292553925549255592556925579255892559925609256192562925639256492565925669256792568925699257092571925729257392574925759257692577925789257992580925819258292583925849258592586925879258892589925909259192592925939259492595925969259792598925999260092601926029260392604926059260692607926089260992610926119261292613926149261592616926179261892619926209262192622926239262492625926269262792628926299263092631926329263392634926359263692637926389263992640926419264292643926449264592646926479264892649926509265192652926539265492655926569265792658926599266092661926629266392664926659266692667926689266992670926719267292673926749267592676926779267892679926809268192682926839268492685926869268792688926899269092691926929269392694926959269692697926989269992700927019270292703927049270592706927079270892709927109271192712927139271492715927169271792718927199272092721927229272392724927259272692727927289272992730927319273292733927349273592736927379273892739927409274192742927439274492745927469274792748927499275092751927529275392754927559275692757927589275992760927619276292763927649276592766927679276892769927709277192772927739277492775927769277792778927799278092781927829278392784927859278692787927889278992790927919279292793927949279592796927979279892799928009280192802928039280492805928069280792808928099281092811928129281392814928159281692817928189281992820928219282292823928249282592826928279282892829928309283192832928339283492835928369283792838928399284092841928429284392844928459284692847928489284992850928519285292853928549285592856928579285892859928609286192862928639286492865928669286792868928699287092871928729287392874928759287692877928789287992880928819288292883928849288592886928879288892889928909289192892928939289492895928969289792898928999290092901929029290392904929059290692907929089290992910929119291292913929149291592916929179291892919929209292192922929239292492925929269292792928929299293092931929329293392934929359293692937929389293992940929419294292943929449294592946929479294892949929509295192952929539295492955929569295792958929599296092961929629296392964929659296692967929689296992970929719297292973929749297592976929779297892979929809298192982929839298492985929869298792988929899299092991929929299392994929959299692997929989299993000930019300293003930049300593006930079300893009930109301193012930139301493015930169301793018930199302093021930229302393024930259302693027930289302993030930319303293033930349303593036930379303893039930409304193042930439304493045930469304793048930499305093051930529305393054930559305693057930589305993060930619306293063930649306593066930679306893069930709307193072930739307493075930769307793078930799308093081930829308393084930859308693087930889308993090930919309293093930949309593096930979309893099931009310193102931039310493105931069310793108931099311093111931129311393114931159311693117931189311993120931219312293123931249312593126931279312893129931309313193132931339313493135931369313793138931399314093141931429314393144931459314693147931489314993150931519315293153931549315593156931579315893159931609316193162931639316493165931669316793168931699317093171931729317393174931759317693177931789317993180931819318293183931849318593186931879318893189931909319193192931939319493195931969319793198931999320093201932029320393204932059320693207932089320993210932119321293213932149321593216932179321893219932209322193222932239322493225932269322793228932299323093231932329323393234932359323693237932389323993240932419324293243932449324593246932479324893249932509325193252932539325493255932569325793258932599326093261932629326393264932659326693267932689326993270932719327293273932749327593276932779327893279932809328193282932839328493285932869328793288932899329093291932929329393294932959329693297932989329993300933019330293303933049330593306933079330893309933109331193312933139331493315933169331793318933199332093321933229332393324933259332693327933289332993330933319333293333933349333593336933379333893339933409334193342933439334493345933469334793348933499335093351933529335393354933559335693357933589335993360933619336293363933649336593366933679336893369933709337193372933739337493375933769337793378933799338093381933829338393384933859338693387933889338993390933919339293393933949339593396933979339893399934009340193402934039340493405934069340793408934099341093411934129341393414934159341693417934189341993420934219342293423934249342593426934279342893429934309343193432934339343493435934369343793438934399344093441934429344393444934459344693447934489344993450934519345293453934549345593456934579345893459934609346193462934639346493465934669346793468934699347093471934729347393474934759347693477934789347993480934819348293483934849348593486934879348893489934909349193492934939349493495934969349793498934999350093501935029350393504935059350693507935089350993510935119351293513935149351593516935179351893519935209352193522935239352493525935269352793528935299353093531935329353393534935359353693537935389353993540935419354293543935449354593546935479354893549935509355193552935539355493555935569355793558935599356093561935629356393564935659356693567935689356993570935719357293573935749357593576935779357893579935809358193582935839358493585935869358793588935899359093591935929359393594935959359693597935989359993600936019360293603936049360593606936079360893609936109361193612936139361493615936169361793618936199362093621936229362393624936259362693627936289362993630936319363293633936349363593636936379363893639936409364193642936439364493645936469364793648936499365093651936529365393654936559365693657936589365993660936619366293663936649366593666936679366893669936709367193672936739367493675936769367793678936799368093681936829368393684936859368693687936889368993690936919369293693936949369593696936979369893699937009370193702937039370493705937069370793708937099371093711937129371393714937159371693717937189371993720937219372293723937249372593726937279372893729937309373193732937339373493735937369373793738937399374093741937429374393744937459374693747937489374993750937519375293753937549375593756937579375893759937609376193762937639376493765937669376793768937699377093771937729377393774937759377693777937789377993780937819378293783937849378593786937879378893789937909379193792937939379493795937969379793798937999380093801938029380393804938059380693807938089380993810938119381293813938149381593816938179381893819938209382193822938239382493825938269382793828938299383093831938329383393834938359383693837938389383993840938419384293843938449384593846938479384893849938509385193852938539385493855938569385793858938599386093861938629386393864938659386693867938689386993870938719387293873938749387593876938779387893879938809388193882938839388493885938869388793888938899389093891938929389393894938959389693897938989389993900939019390293903939049390593906939079390893909939109391193912939139391493915939169391793918939199392093921939229392393924939259392693927939289392993930939319393293933939349393593936939379393893939939409394193942939439394493945939469394793948939499395093951939529395393954939559395693957939589395993960939619396293963939649396593966939679396893969939709397193972939739397493975939769397793978939799398093981939829398393984939859398693987939889398993990939919399293993939949399593996939979399893999940009400194002940039400494005940069400794008940099401094011940129401394014940159401694017940189401994020940219402294023940249402594026940279402894029940309403194032940339403494035940369403794038940399404094041940429404394044940459404694047940489404994050940519405294053940549405594056940579405894059940609406194062940639406494065940669406794068940699407094071940729407394074940759407694077940789407994080940819408294083940849408594086940879408894089940909409194092940939409494095940969409794098940999410094101941029410394104941059410694107941089410994110941119411294113941149411594116941179411894119941209412194122941239412494125941269412794128941299413094131941329413394134941359413694137941389413994140941419414294143941449414594146941479414894149941509415194152941539415494155941569415794158941599416094161941629416394164941659416694167941689416994170941719417294173941749417594176941779417894179941809418194182941839418494185941869418794188941899419094191941929419394194941959419694197941989419994200942019420294203942049420594206942079420894209942109421194212942139421494215942169421794218942199422094221942229422394224942259422694227942289422994230942319423294233942349423594236942379423894239942409424194242942439424494245942469424794248942499425094251942529425394254942559425694257942589425994260942619426294263942649426594266942679426894269942709427194272942739427494275942769427794278942799428094281942829428394284942859428694287942889428994290942919429294293942949429594296942979429894299943009430194302943039430494305943069430794308943099431094311943129431394314943159431694317943189431994320943219432294323943249432594326943279432894329943309433194332943339433494335943369433794338943399434094341943429434394344943459434694347943489434994350943519435294353943549435594356943579435894359943609436194362943639436494365943669436794368943699437094371943729437394374943759437694377943789437994380943819438294383943849438594386943879438894389943909439194392943939439494395943969439794398943999440094401944029440394404944059440694407944089440994410944119441294413944149441594416944179441894419944209442194422944239442494425944269442794428944299443094431944329443394434944359443694437944389443994440944419444294443944449444594446944479444894449944509445194452944539445494455944569445794458944599446094461944629446394464944659446694467944689446994470944719447294473944749447594476944779447894479944809448194482944839448494485944869448794488944899449094491944929449394494944959449694497944989449994500945019450294503945049450594506945079450894509945109451194512945139451494515945169451794518945199452094521945229452394524945259452694527945289452994530945319453294533945349453594536945379453894539945409454194542945439454494545945469454794548945499455094551945529455394554945559455694557945589455994560945619456294563945649456594566945679456894569945709457194572945739457494575945769457794578945799458094581945829458394584945859458694587945889458994590945919459294593945949459594596945979459894599946009460194602946039460494605946069460794608946099461094611946129461394614946159461694617946189461994620946219462294623946249462594626946279462894629946309463194632946339463494635946369463794638946399464094641946429464394644946459464694647946489464994650946519465294653946549465594656946579465894659946609466194662946639466494665946669466794668946699467094671946729467394674946759467694677946789467994680946819468294683946849468594686946879468894689946909469194692946939469494695946969469794698946999470094701947029470394704947059470694707947089470994710947119471294713947149471594716947179471894719947209472194722947239472494725947269472794728947299473094731947329473394734947359473694737947389473994740947419474294743947449474594746947479474894749947509475194752947539475494755947569475794758947599476094761947629476394764947659476694767947689476994770947719477294773947749477594776947779477894779947809478194782947839478494785947869478794788947899479094791947929479394794947959479694797947989479994800948019480294803948049480594806948079480894809948109481194812948139481494815948169481794818948199482094821948229482394824948259482694827948289482994830948319483294833948349483594836948379483894839948409484194842948439484494845948469484794848948499485094851948529485394854948559485694857948589485994860948619486294863948649486594866948679486894869948709487194872948739487494875948769487794878948799488094881948829488394884948859488694887948889488994890948919489294893948949489594896948979489894899949009490194902949039490494905949069490794908949099491094911949129491394914949159491694917949189491994920949219492294923949249492594926949279492894929949309493194932949339493494935949369493794938949399494094941949429494394944949459494694947949489494994950949519495294953949549495594956949579495894959949609496194962949639496494965949669496794968949699497094971949729497394974949759497694977949789497994980949819498294983949849498594986949879498894989949909499194992949939499494995949969499794998949999500095001950029500395004950059500695007950089500995010950119501295013950149501595016950179501895019950209502195022950239502495025950269502795028950299503095031950329503395034950359503695037950389503995040950419504295043950449504595046950479504895049950509505195052950539505495055950569505795058950599506095061950629506395064950659506695067950689506995070950719507295073950749507595076950779507895079950809508195082950839508495085950869508795088950899509095091950929509395094950959509695097950989509995100951019510295103951049510595106951079510895109951109511195112951139511495115951169511795118951199512095121951229512395124951259512695127951289512995130951319513295133951349513595136951379513895139951409514195142951439514495145951469514795148951499515095151951529515395154951559515695157951589515995160951619516295163951649516595166951679516895169951709517195172951739517495175951769517795178951799518095181951829518395184951859518695187951889518995190951919519295193951949519595196951979519895199952009520195202952039520495205952069520795208952099521095211952129521395214952159521695217952189521995220952219522295223952249522595226952279522895229952309523195232952339523495235952369523795238952399524095241952429524395244952459524695247952489524995250952519525295253952549525595256952579525895259952609526195262952639526495265952669526795268952699527095271952729527395274952759527695277952789527995280952819528295283952849528595286952879528895289952909529195292952939529495295952969529795298952999530095301953029530395304953059530695307953089530995310953119531295313953149531595316953179531895319953209532195322953239532495325953269532795328953299533095331953329533395334953359533695337953389533995340953419534295343953449534595346953479534895349953509535195352953539535495355953569535795358953599536095361953629536395364953659536695367953689536995370953719537295373953749537595376953779537895379953809538195382953839538495385953869538795388953899539095391953929539395394953959539695397953989539995400954019540295403954049540595406954079540895409954109541195412954139541495415954169541795418954199542095421954229542395424954259542695427954289542995430954319543295433954349543595436954379543895439954409544195442954439544495445954469544795448954499545095451954529545395454954559545695457954589545995460954619546295463954649546595466954679546895469954709547195472954739547495475954769547795478954799548095481954829548395484954859548695487954889548995490954919549295493954949549595496954979549895499955009550195502955039550495505955069550795508955099551095511955129551395514955159551695517955189551995520955219552295523955249552595526955279552895529955309553195532955339553495535955369553795538955399554095541955429554395544955459554695547955489554995550955519555295553955549555595556955579555895559955609556195562955639556495565955669556795568955699557095571955729557395574955759557695577955789557995580955819558295583955849558595586955879558895589955909559195592955939559495595955969559795598955999560095601956029560395604956059560695607956089560995610956119561295613956149561595616956179561895619956209562195622956239562495625956269562795628956299563095631956329563395634956359563695637956389563995640956419564295643956449564595646956479564895649956509565195652956539565495655956569565795658956599566095661956629566395664956659566695667956689566995670956719567295673956749567595676956779567895679956809568195682956839568495685956869568795688956899569095691956929569395694956959569695697956989569995700957019570295703957049570595706957079570895709957109571195712957139571495715957169571795718957199572095721957229572395724957259572695727957289572995730957319573295733957349573595736957379573895739957409574195742957439574495745957469574795748957499575095751957529575395754957559575695757957589575995760957619576295763957649576595766957679576895769957709577195772957739577495775957769577795778957799578095781957829578395784957859578695787957889578995790957919579295793957949579595796957979579895799958009580195802958039580495805958069580795808958099581095811958129581395814958159581695817958189581995820958219582295823958249582595826958279582895829958309583195832958339583495835958369583795838958399584095841958429584395844958459584695847958489584995850958519585295853958549585595856958579585895859958609586195862958639586495865958669586795868958699587095871958729587395874958759587695877958789587995880958819588295883958849588595886958879588895889958909589195892958939589495895958969589795898958999590095901959029590395904959059590695907959089590995910959119591295913959149591595916959179591895919959209592195922959239592495925959269592795928959299593095931959329593395934959359593695937959389593995940959419594295943959449594595946959479594895949959509595195952959539595495955959569595795958959599596095961959629596395964959659596695967959689596995970959719597295973959749597595976959779597895979959809598195982959839598495985959869598795988959899599095991959929599395994959959599695997959989599996000960019600296003960049600596006960079600896009960109601196012960139601496015960169601796018960199602096021960229602396024960259602696027960289602996030960319603296033960349603596036960379603896039960409604196042960439604496045960469604796048960499605096051960529605396054960559605696057960589605996060960619606296063960649606596066960679606896069960709607196072960739607496075960769607796078960799608096081960829608396084960859608696087960889608996090960919609296093960949609596096960979609896099961009610196102961039610496105961069610796108961099611096111961129611396114961159611696117961189611996120961219612296123961249612596126961279612896129961309613196132961339613496135961369613796138961399614096141961429614396144961459614696147961489614996150961519615296153961549615596156961579615896159961609616196162961639616496165961669616796168961699617096171961729617396174961759617696177961789617996180961819618296183961849618596186961879618896189961909619196192961939619496195961969619796198961999620096201962029620396204962059620696207962089620996210962119621296213962149621596216962179621896219962209622196222962239622496225962269622796228962299623096231962329623396234962359623696237962389623996240962419624296243962449624596246962479624896249962509625196252962539625496255962569625796258962599626096261962629626396264962659626696267962689626996270962719627296273962749627596276962779627896279962809628196282962839628496285962869628796288962899629096291962929629396294962959629696297962989629996300963019630296303963049630596306963079630896309963109631196312963139631496315963169631796318963199632096321963229632396324963259632696327963289632996330963319633296333963349633596336963379633896339963409634196342963439634496345963469634796348963499635096351963529635396354963559635696357963589635996360963619636296363963649636596366963679636896369963709637196372963739637496375963769637796378963799638096381963829638396384963859638696387963889638996390963919639296393963949639596396963979639896399964009640196402964039640496405964069640796408964099641096411964129641396414964159641696417964189641996420964219642296423964249642596426964279642896429964309643196432964339643496435964369643796438964399644096441964429644396444964459644696447964489644996450964519645296453964549645596456964579645896459964609646196462964639646496465964669646796468964699647096471964729647396474964759647696477964789647996480964819648296483964849648596486964879648896489964909649196492964939649496495964969649796498964999650096501965029650396504965059650696507965089650996510965119651296513965149651596516965179651896519965209652196522965239652496525965269652796528965299653096531965329653396534965359653696537965389653996540965419654296543965449654596546965479654896549965509655196552965539655496555965569655796558965599656096561965629656396564965659656696567965689656996570965719657296573965749657596576965779657896579965809658196582965839658496585965869658796588965899659096591965929659396594965959659696597965989659996600966019660296603966049660596606966079660896609966109661196612966139661496615966169661796618966199662096621966229662396624966259662696627966289662996630966319663296633966349663596636966379663896639966409664196642966439664496645966469664796648966499665096651966529665396654966559665696657966589665996660966619666296663966649666596666966679666896669966709667196672966739667496675966769667796678966799668096681966829668396684966859668696687966889668996690966919669296693966949669596696966979669896699967009670196702967039670496705967069670796708967099671096711967129671396714967159671696717967189671996720967219672296723967249672596726967279672896729967309673196732967339673496735967369673796738967399674096741967429674396744967459674696747967489674996750967519675296753967549675596756967579675896759967609676196762967639676496765967669676796768967699677096771967729677396774967759677696777967789677996780967819678296783967849678596786967879678896789967909679196792967939679496795967969679796798967999680096801968029680396804968059680696807968089680996810968119681296813968149681596816968179681896819968209682196822968239682496825968269682796828968299683096831968329683396834968359683696837968389683996840968419684296843968449684596846968479684896849968509685196852968539685496855968569685796858968599686096861968629686396864968659686696867968689686996870968719687296873968749687596876968779687896879968809688196882968839688496885968869688796888968899689096891968929689396894968959689696897968989689996900969019690296903969049690596906969079690896909969109691196912969139691496915969169691796918969199692096921969229692396924969259692696927969289692996930969319693296933969349693596936969379693896939969409694196942969439694496945969469694796948969499695096951969529695396954969559695696957969589695996960969619696296963969649696596966969679696896969969709697196972969739697496975969769697796978969799698096981969829698396984969859698696987969889698996990969919699296993969949699596996969979699896999970009700197002970039700497005970069700797008970099701097011970129701397014970159701697017970189701997020970219702297023970249702597026970279702897029970309703197032970339703497035970369703797038970399704097041970429704397044970459704697047970489704997050970519705297053970549705597056970579705897059970609706197062970639706497065970669706797068970699707097071970729707397074970759707697077970789707997080970819708297083970849708597086970879708897089970909709197092970939709497095970969709797098970999710097101971029710397104971059710697107971089710997110971119711297113971149711597116971179711897119971209712197122971239712497125971269712797128971299713097131971329713397134971359713697137971389713997140971419714297143971449714597146971479714897149971509715197152971539715497155971569715797158971599716097161971629716397164971659716697167971689716997170971719717297173971749717597176971779717897179971809718197182971839718497185971869718797188971899719097191971929719397194971959719697197971989719997200972019720297203972049720597206972079720897209972109721197212972139721497215972169721797218972199722097221972229722397224972259722697227972289722997230972319723297233972349723597236972379723897239972409724197242972439724497245972469724797248972499725097251972529725397254972559725697257972589725997260972619726297263972649726597266972679726897269972709727197272972739727497275972769727797278972799728097281972829728397284972859728697287972889728997290972919729297293972949729597296972979729897299973009730197302973039730497305973069730797308973099731097311973129731397314973159731697317973189731997320973219732297323973249732597326973279732897329973309733197332973339733497335973369733797338973399734097341973429734397344973459734697347973489734997350973519735297353973549735597356973579735897359973609736197362973639736497365973669736797368973699737097371973729737397374973759737697377973789737997380973819738297383973849738597386973879738897389973909739197392973939739497395973969739797398973999740097401974029740397404974059740697407974089740997410974119741297413974149741597416974179741897419974209742197422974239742497425974269742797428974299743097431974329743397434974359743697437974389743997440974419744297443974449744597446974479744897449974509745197452974539745497455974569745797458974599746097461974629746397464974659746697467974689746997470974719747297473974749747597476974779747897479974809748197482974839748497485974869748797488974899749097491974929749397494974959749697497974989749997500975019750297503975049750597506975079750897509975109751197512975139751497515975169751797518975199752097521975229752397524975259752697527975289752997530975319753297533975349753597536975379753897539975409754197542975439754497545975469754797548975499755097551975529755397554975559755697557975589755997560975619756297563975649756597566975679756897569975709757197572975739757497575975769757797578975799758097581975829758397584975859758697587975889758997590975919759297593975949759597596975979759897599976009760197602976039760497605976069760797608976099761097611976129761397614976159761697617976189761997620976219762297623976249762597626976279762897629976309763197632976339763497635976369763797638976399764097641976429764397644976459764697647976489764997650976519765297653976549765597656976579765897659976609766197662976639766497665976669766797668976699767097671976729767397674976759767697677976789767997680976819768297683976849768597686976879768897689976909769197692976939769497695976969769797698976999770097701977029770397704977059770697707977089770997710977119771297713977149771597716977179771897719977209772197722977239772497725977269772797728977299773097731977329773397734977359773697737977389773997740977419774297743977449774597746977479774897749977509775197752977539775497755977569775797758977599776097761977629776397764977659776697767977689776997770977719777297773977749777597776977779777897779977809778197782977839778497785977869778797788977899779097791977929779397794977959779697797977989779997800978019780297803978049780597806978079780897809978109781197812978139781497815978169781797818978199782097821978229782397824978259782697827978289782997830978319783297833978349783597836978379783897839978409784197842978439784497845978469784797848978499785097851978529785397854978559785697857978589785997860978619786297863978649786597866978679786897869978709787197872978739787497875978769787797878978799788097881978829788397884978859788697887978889788997890978919789297893978949789597896978979789897899979009790197902979039790497905979069790797908979099791097911979129791397914979159791697917979189791997920979219792297923979249792597926979279792897929979309793197932979339793497935979369793797938979399794097941979429794397944979459794697947979489794997950979519795297953979549795597956979579795897959979609796197962979639796497965979669796797968979699797097971979729797397974979759797697977979789797997980979819798297983979849798597986979879798897989979909799197992979939799497995979969799797998979999800098001980029800398004980059800698007980089800998010980119801298013980149801598016980179801898019980209802198022980239802498025980269802798028980299803098031980329803398034980359803698037980389803998040980419804298043980449804598046980479804898049980509805198052980539805498055980569805798058980599806098061980629806398064980659806698067980689806998070980719807298073980749807598076980779807898079980809808198082980839808498085980869808798088980899809098091980929809398094980959809698097980989809998100981019810298103981049810598106981079810898109981109811198112981139811498115981169811798118981199812098121981229812398124981259812698127981289812998130981319813298133981349813598136981379813898139981409814198142981439814498145981469814798148981499815098151981529815398154981559815698157981589815998160981619816298163981649816598166981679816898169981709817198172981739817498175981769817798178981799818098181981829818398184981859818698187981889818998190981919819298193981949819598196981979819898199982009820198202982039820498205982069820798208982099821098211982129821398214982159821698217982189821998220982219822298223982249822598226982279822898229982309823198232982339823498235982369823798238982399824098241982429824398244982459824698247982489824998250982519825298253982549825598256982579825898259982609826198262982639826498265982669826798268982699827098271982729827398274982759827698277982789827998280982819828298283982849828598286982879828898289982909829198292982939829498295982969829798298982999830098301983029830398304983059830698307983089830998310983119831298313983149831598316983179831898319983209832198322983239832498325983269832798328983299833098331983329833398334983359833698337983389833998340983419834298343983449834598346983479834898349983509835198352983539835498355983569835798358983599836098361983629836398364983659836698367983689836998370983719837298373983749837598376983779837898379983809838198382983839838498385983869838798388983899839098391983929839398394983959839698397983989839998400984019840298403984049840598406984079840898409984109841198412984139841498415984169841798418984199842098421984229842398424984259842698427984289842998430984319843298433984349843598436984379843898439984409844198442984439844498445984469844798448984499845098451984529845398454984559845698457984589845998460984619846298463984649846598466984679846898469984709847198472984739847498475984769847798478984799848098481984829848398484984859848698487984889848998490984919849298493984949849598496984979849898499985009850198502985039850498505985069850798508985099851098511985129851398514985159851698517985189851998520985219852298523985249852598526985279852898529985309853198532985339853498535985369853798538985399854098541985429854398544985459854698547985489854998550985519855298553985549855598556985579855898559985609856198562985639856498565985669856798568985699857098571985729857398574985759857698577985789857998580985819858298583985849858598586985879858898589985909859198592985939859498595985969859798598985999860098601986029860398604986059860698607986089860998610986119861298613986149861598616986179861898619986209862198622986239862498625986269862798628986299863098631986329863398634986359863698637986389863998640986419864298643986449864598646986479864898649986509865198652986539865498655986569865798658986599866098661986629866398664986659866698667986689866998670986719867298673986749867598676986779867898679986809868198682986839868498685986869868798688986899869098691986929869398694986959869698697986989869998700987019870298703987049870598706987079870898709987109871198712987139871498715987169871798718987199872098721987229872398724987259872698727987289872998730987319873298733987349873598736987379873898739987409874198742987439874498745987469874798748987499875098751987529875398754987559875698757987589875998760987619876298763987649876598766987679876898769987709877198772987739877498775987769877798778987799878098781987829878398784987859878698787987889878998790987919879298793987949879598796987979879898799988009880198802988039880498805988069880798808988099881098811988129881398814988159881698817988189881998820988219882298823988249882598826988279882898829988309883198832988339883498835988369883798838988399884098841988429884398844988459884698847988489884998850988519885298853988549885598856988579885898859988609886198862988639886498865988669886798868988699887098871988729887398874988759887698877988789887998880988819888298883988849888598886988879888898889988909889198892988939889498895988969889798898988999890098901989029890398904989059890698907989089890998910989119891298913989149891598916989179891898919989209892198922989239892498925989269892798928989299893098931989329893398934989359893698937989389893998940989419894298943989449894598946989479894898949989509895198952989539895498955989569895798958989599896098961989629896398964989659896698967989689896998970989719897298973989749897598976989779897898979989809898198982989839898498985989869898798988989899899098991989929899398994989959899698997989989899999000990019900299003990049900599006990079900899009990109901199012990139901499015990169901799018990199902099021990229902399024990259902699027990289902999030990319903299033990349903599036990379903899039990409904199042990439904499045990469904799048990499905099051990529905399054990559905699057990589905999060990619906299063990649906599066990679906899069990709907199072990739907499075990769907799078990799908099081990829908399084990859908699087990889908999090990919909299093990949909599096990979909899099991009910199102991039910499105991069910799108991099911099111991129911399114991159911699117991189911999120991219912299123991249912599126991279912899129991309913199132991339913499135991369913799138991399914099141991429914399144991459914699147991489914999150991519915299153991549915599156991579915899159991609916199162991639916499165991669916799168991699917099171991729917399174991759917699177991789917999180991819918299183991849918599186991879918899189991909919199192991939919499195991969919799198991999920099201992029920399204992059920699207992089920999210992119921299213992149921599216992179921899219992209922199222992239922499225992269922799228992299923099231992329923399234992359923699237992389923999240992419924299243992449924599246992479924899249992509925199252992539925499255992569925799258992599926099261992629926399264992659926699267992689926999270992719927299273992749927599276992779927899279992809928199282992839928499285992869928799288992899929099291992929929399294992959929699297992989929999300993019930299303993049930599306993079930899309993109931199312993139931499315993169931799318993199932099321993229932399324993259932699327993289932999330993319933299333993349933599336993379933899339993409934199342993439934499345993469934799348993499935099351993529935399354993559935699357993589935999360993619936299363993649936599366993679936899369993709937199372993739937499375993769937799378993799938099381993829938399384993859938699387993889938999390993919939299393993949939599396993979939899399994009940199402994039940499405994069940799408994099941099411994129941399414994159941699417994189941999420994219942299423994249942599426994279942899429994309943199432994339943499435994369943799438994399944099441994429944399444994459944699447994489944999450994519945299453994549945599456994579945899459994609946199462994639946499465994669946799468994699947099471994729947399474994759947699477994789947999480994819948299483994849948599486994879948899489994909949199492994939949499495994969949799498994999950099501995029950399504995059950699507995089950999510995119951299513995149951599516995179951899519995209952199522995239952499525995269952799528995299953099531995329953399534995359953699537995389953999540995419954299543995449954599546995479954899549995509955199552995539955499555995569955799558995599956099561995629956399564995659956699567995689956999570995719957299573995749957599576995779957899579995809958199582995839958499585995869958799588995899959099591995929959399594995959959699597995989959999600996019960299603996049960599606996079960899609996109961199612996139961499615996169961799618996199962099621996229962399624996259962699627996289962999630996319963299633996349963599636996379963899639996409964199642996439964499645996469964799648996499965099651996529965399654996559965699657996589965999660996619966299663996649966599666996679966899669996709967199672996739967499675996769967799678996799968099681996829968399684996859968699687996889968999690996919969299693996949969599696996979969899699997009970199702997039970499705997069970799708997099971099711997129971399714997159971699717997189971999720997219972299723997249972599726997279972899729997309973199732997339973499735997369973799738997399974099741997429974399744997459974699747997489974999750997519975299753997549975599756997579975899759997609976199762997639976499765997669976799768997699977099771997729977399774997759977699777997789977999780997819978299783997849978599786997879978899789997909979199792997939979499795997969979799798997999980099801998029980399804998059980699807998089980999810998119981299813998149981599816998179981899819998209982199822998239982499825998269982799828998299983099831998329983399834998359983699837998389983999840998419984299843998449984599846998479984899849998509985199852998539985499855998569985799858998599986099861998629986399864998659986699867998689986999870998719987299873998749987599876998779987899879998809988199882998839988499885998869988799888998899989099891998929989399894998959989699897998989989999900999019990299903999049990599906999079990899909999109991199912999139991499915999169991799918999199992099921999229992399924999259992699927999289992999930999319993299933999349993599936999379993899939999409994199942999439994499945999469994799948999499995099951999529995399954999559995699957999589995999960999619996299963999649996599966999679996899969999709997199972999739997499975999769997799978999799998099981999829998399984999859998699987999889998999990999919999299993999949999599996999979999899999100000100001100002100003100004100005100006100007100008100009100010100011100012100013100014100015100016100017100018100019100020100021100022100023100024100025100026100027100028100029100030100031100032100033100034100035100036100037100038100039100040100041100042100043100044100045100046100047100048100049100050100051100052100053100054100055100056100057100058100059100060100061100062100063100064100065100066100067100068100069100070100071100072100073100074100075100076100077100078100079100080100081100082100083100084100085100086100087100088100089100090100091100092100093100094100095100096100097100098100099100100100101100102100103100104100105100106100107100108100109100110100111100112100113100114100115100116100117100118100119100120100121100122100123100124100125100126100127100128100129100130100131100132100133100134100135100136100137100138100139100140100141100142100143100144100145100146100147100148100149100150100151100152100153100154100155100156100157100158100159100160100161100162100163100164100165100166100167100168100169100170100171100172100173100174100175100176100177100178100179100180100181100182100183100184100185100186100187100188100189100190100191100192100193100194100195100196100197100198100199100200100201100202100203100204100205100206100207100208100209100210100211100212100213100214100215100216100217100218100219100220100221100222100223100224100225100226100227100228100229100230100231100232100233100234100235100236100237100238100239100240100241100242100243100244100245100246100247100248100249100250100251100252100253100254100255100256100257100258100259100260100261100262100263100264100265100266100267100268100269100270100271100272100273100274100275100276100277100278100279100280100281100282100283100284100285100286100287100288100289100290100291100292100293100294100295100296100297100298100299100300100301100302100303100304100305100306100307100308100309100310100311100312100313100314100315100316100317100318100319100320100321100322100323100324100325100326100327100328100329100330100331100332100333100334100335100336100337100338100339100340100341100342100343100344100345100346100347100348100349100350100351100352100353100354100355100356100357100358100359100360100361100362100363100364100365100366100367100368100369100370100371100372100373100374100375100376100377100378100379100380100381100382100383100384100385100386100387100388100389100390100391100392100393100394100395100396100397100398100399100400100401100402100403100404100405100406100407100408100409100410100411100412100413100414100415100416100417100418100419100420100421100422100423100424100425100426100427100428100429100430100431100432100433100434100435100436100437100438100439100440100441100442100443100444100445100446100447100448100449100450100451100452100453100454100455100456100457100458100459100460100461100462100463100464100465100466100467100468100469100470100471100472100473100474100475100476100477100478100479100480100481100482100483100484100485100486100487100488100489100490100491100492100493100494100495100496100497100498100499100500100501100502100503100504100505100506100507100508100509100510100511100512100513100514100515100516100517100518100519100520100521100522100523100524100525100526100527100528100529100530100531100532100533100534100535100536100537100538100539100540100541100542100543100544100545100546100547100548100549100550100551100552100553100554100555100556100557100558100559100560100561100562100563100564100565100566100567100568100569100570100571100572100573100574100575100576100577100578100579100580100581100582100583100584100585100586100587100588100589100590100591100592100593100594100595100596100597100598100599100600100601100602100603100604100605100606100607100608100609100610100611100612100613100614100615100616100617100618100619100620100621100622100623100624100625100626100627100628100629100630100631100632100633100634100635100636100637100638100639100640100641100642100643100644100645100646100647100648100649100650100651100652100653100654100655100656100657100658100659100660100661100662100663100664100665100666100667100668100669100670100671100672100673100674100675100676100677100678100679100680100681100682100683100684100685100686100687100688100689100690100691100692100693100694100695100696100697100698100699100700100701100702100703100704100705100706100707100708100709100710100711100712100713100714100715100716100717100718100719100720100721100722100723100724100725100726100727100728100729100730100731100732100733100734100735100736100737100738100739100740100741100742100743100744100745100746100747100748100749100750100751100752100753100754100755100756100757100758100759100760100761100762100763100764100765100766100767100768100769100770100771100772100773100774100775100776100777100778100779100780100781100782100783100784100785100786100787100788100789100790100791100792100793100794100795100796100797100798100799100800100801100802100803100804100805100806100807100808100809100810100811100812100813100814100815100816100817100818100819100820100821100822100823100824100825100826100827100828100829100830100831100832100833100834100835100836100837100838100839100840100841100842100843100844100845100846100847100848100849100850100851100852100853100854100855100856100857100858100859100860100861100862100863100864100865100866100867100868100869100870100871100872100873100874100875100876100877100878100879100880100881100882100883100884100885100886100887100888100889100890100891100892100893100894100895100896100897100898100899100900100901100902100903100904100905100906100907100908100909100910100911100912100913100914100915100916100917100918100919100920100921100922100923100924100925100926100927100928100929100930100931100932100933100934100935100936100937100938100939100940100941100942100943100944100945100946100947100948100949100950100951100952100953100954100955100956100957100958100959100960100961100962100963100964100965100966100967100968100969100970100971100972100973100974100975100976100977100978100979100980100981100982100983100984100985100986100987100988100989100990100991100992100993100994100995100996100997100998100999101000101001101002101003101004101005101006101007101008101009101010101011101012101013101014101015101016101017101018101019101020101021101022101023101024101025101026101027101028101029101030101031101032101033101034101035101036101037101038101039101040101041101042101043101044101045101046101047101048101049101050101051101052101053101054101055101056101057101058101059101060101061101062101063101064101065101066101067101068101069101070101071101072101073101074101075101076101077101078101079101080101081101082101083101084101085101086101087101088101089101090101091101092101093101094101095101096101097101098101099101100101101101102101103101104101105101106101107101108101109101110101111101112101113101114101115101116101117101118101119101120101121101122101123101124101125101126101127101128101129101130101131101132101133101134101135101136101137101138101139101140101141101142101143101144101145101146101147101148101149101150101151101152101153101154101155101156101157101158101159101160101161101162101163101164101165101166101167101168101169101170101171101172101173101174101175101176101177101178101179101180101181101182101183101184101185101186101187101188101189101190101191101192101193101194101195101196101197101198101199101200101201101202101203101204101205101206101207101208101209101210101211101212101213101214101215101216101217101218101219101220101221101222101223101224101225101226101227101228101229101230101231101232101233101234101235101236101237101238101239101240101241101242101243101244101245101246101247101248101249101250101251101252101253101254101255101256101257101258101259101260101261101262101263101264101265101266101267101268101269101270101271101272101273101274101275101276101277101278101279101280101281101282101283101284101285101286101287101288101289101290101291101292101293101294101295101296101297101298101299101300101301101302101303101304101305101306101307101308101309101310101311101312101313101314101315101316101317101318101319101320101321101322101323101324101325101326101327101328101329101330101331101332101333101334101335101336101337101338101339101340101341101342101343101344101345101346101347101348101349101350101351101352101353101354101355101356101357101358101359101360101361101362101363101364101365101366101367101368101369101370101371101372101373101374101375101376101377101378101379101380101381101382101383101384101385101386101387101388101389101390101391101392101393101394101395101396101397101398101399101400101401101402101403101404101405101406101407101408101409101410101411101412101413101414101415101416101417101418101419101420101421101422101423101424101425101426101427101428101429101430101431101432101433101434101435101436101437101438101439101440101441101442101443101444101445101446101447101448101449101450101451101452101453101454101455101456101457101458101459101460101461101462101463101464101465101466101467101468101469101470101471101472101473101474101475101476101477101478101479101480101481101482101483101484101485101486101487101488101489101490101491101492101493101494101495101496101497101498101499101500101501101502101503101504101505101506101507101508101509101510101511101512101513101514101515101516101517101518101519101520101521101522101523101524101525101526101527101528101529101530101531101532101533101534101535101536101537101538101539101540101541101542101543101544101545101546101547101548101549101550101551101552101553101554101555101556101557101558101559101560101561101562101563101564101565101566101567101568101569101570101571101572101573101574101575101576101577101578101579101580101581101582101583101584101585101586101587101588101589101590101591101592101593101594101595101596101597101598101599101600101601101602101603101604101605101606101607101608101609101610101611101612101613101614101615101616101617101618101619101620101621101622101623101624101625101626101627101628101629101630101631101632101633101634101635101636101637101638101639101640101641101642101643101644101645101646101647101648101649101650101651101652101653101654101655101656101657101658101659101660101661101662101663101664101665101666101667101668101669101670101671101672101673101674101675101676101677101678101679101680101681101682101683101684101685101686101687101688101689101690101691101692101693101694101695101696101697101698101699101700101701101702101703101704101705101706101707101708101709101710101711101712101713101714101715101716101717101718101719101720101721101722101723101724101725101726101727101728101729101730101731101732101733101734101735101736101737101738101739101740101741101742101743101744101745101746101747101748101749101750101751101752101753101754101755101756101757101758101759101760101761101762101763101764101765101766101767101768101769101770101771101772101773101774101775101776101777101778101779101780101781101782101783101784101785101786101787101788101789101790101791101792101793101794101795101796101797101798101799101800101801101802101803101804101805101806101807101808101809101810101811101812101813101814101815101816101817101818101819101820101821101822101823101824101825101826101827101828101829101830101831101832101833101834101835101836101837101838101839101840101841101842101843101844101845101846101847101848101849101850101851101852101853101854101855101856101857101858101859101860101861101862101863101864101865101866101867101868101869101870101871101872101873101874101875101876101877101878101879101880101881101882101883101884101885101886101887101888101889101890101891101892101893101894101895101896101897101898101899101900101901101902101903101904101905101906101907101908101909101910101911101912101913101914101915101916101917101918101919101920101921101922101923101924101925101926101927101928101929101930101931101932101933101934101935101936101937101938101939101940101941101942101943101944101945101946101947101948101949101950101951101952101953101954101955101956101957101958101959101960101961101962101963101964101965101966101967101968101969101970101971101972101973101974101975101976101977101978101979101980101981101982101983101984101985101986101987101988101989101990101991101992101993101994101995101996101997101998101999102000102001102002102003102004102005102006102007102008102009102010102011102012102013102014102015102016102017102018102019102020102021102022102023102024102025102026102027102028102029102030102031102032102033102034102035102036102037102038102039102040102041102042102043102044102045102046102047102048102049102050102051102052102053102054102055102056102057102058102059102060102061102062102063102064102065102066102067102068102069102070102071102072102073102074102075102076102077102078102079102080102081102082102083102084102085102086102087102088102089102090102091102092102093102094102095102096102097102098102099102100102101102102102103102104102105102106102107102108102109102110102111102112102113102114102115102116102117102118102119102120102121102122102123102124102125102126102127102128102129102130102131102132102133102134102135102136102137102138102139102140102141102142102143102144102145102146102147102148102149102150102151102152102153102154102155102156102157102158102159102160102161102162102163102164102165102166102167102168102169102170102171102172102173102174102175102176102177102178102179102180102181102182102183102184102185102186102187102188102189102190102191102192102193102194102195102196102197102198102199102200102201102202102203102204102205102206102207102208102209102210102211102212102213102214102215102216102217102218102219102220102221102222102223102224102225102226102227102228102229102230102231102232102233102234102235102236102237102238102239102240102241102242102243102244102245102246102247102248102249102250102251102252102253102254102255102256102257102258102259102260102261102262102263102264102265102266102267102268102269102270102271102272102273102274102275102276102277102278102279102280102281102282102283102284102285102286102287102288102289102290102291102292102293102294102295102296102297102298102299102300102301102302102303102304102305102306102307102308102309102310102311102312102313102314102315102316102317102318102319102320102321102322102323102324102325102326102327102328102329102330102331102332102333102334102335102336102337102338102339102340102341102342102343102344102345102346102347102348102349102350102351102352102353102354102355102356102357102358102359102360102361102362102363102364102365102366102367102368102369102370102371102372102373102374102375102376102377102378102379102380102381102382102383102384102385102386102387102388102389102390102391102392102393102394102395102396102397102398102399102400102401102402102403102404102405102406102407102408102409102410102411102412102413102414102415102416102417102418102419102420102421102422102423102424102425102426102427102428102429102430102431102432102433102434102435102436102437102438102439102440102441102442102443102444102445102446102447102448102449102450102451102452102453102454102455102456102457102458102459102460102461102462102463102464102465102466102467102468102469102470102471102472102473102474102475102476102477102478102479102480102481102482102483102484102485102486102487102488102489102490102491102492102493102494102495102496102497102498102499102500102501102502102503102504102505102506102507102508102509102510102511102512102513102514102515102516102517102518102519102520102521102522102523102524102525102526102527102528102529102530102531102532102533102534102535102536102537102538102539102540102541102542102543102544102545102546102547102548102549102550102551102552102553102554102555102556102557102558102559102560102561102562102563102564102565102566102567102568102569102570102571102572102573102574102575102576102577102578102579102580102581102582102583102584102585102586102587102588102589102590102591102592102593102594102595102596102597102598102599102600102601102602102603102604102605102606102607102608102609102610102611102612102613102614102615102616102617102618102619102620102621102622102623102624102625102626102627102628102629102630102631102632102633102634102635102636102637102638102639102640102641102642102643102644102645102646102647102648102649102650102651102652102653102654102655102656102657102658102659102660102661102662102663102664102665102666102667102668102669102670102671102672102673102674102675102676102677102678102679102680102681102682102683102684102685102686102687102688102689102690102691102692102693102694102695102696102697102698102699102700102701102702102703102704102705102706102707102708102709102710102711102712102713102714102715102716102717102718102719102720102721102722102723102724102725102726102727102728102729102730102731102732102733102734102735102736102737102738102739102740102741102742102743102744102745102746102747102748102749102750102751102752102753102754102755102756102757102758102759102760102761102762102763102764102765102766102767102768102769102770102771102772102773102774102775102776102777102778102779102780102781102782102783102784102785102786102787102788102789102790102791102792102793102794102795102796102797102798102799102800102801102802102803102804102805102806102807102808102809102810102811102812102813102814102815102816102817102818102819102820102821102822102823102824102825102826102827102828102829102830102831102832102833102834102835102836102837102838102839102840102841102842102843102844102845102846102847102848102849102850102851102852102853102854102855102856102857102858102859102860102861102862102863102864102865102866102867102868102869102870102871102872102873102874102875102876102877102878102879102880102881102882102883102884102885102886102887102888102889102890102891102892102893102894102895102896102897102898102899102900102901102902102903102904102905102906102907102908102909102910102911102912102913102914102915102916102917102918102919102920102921102922102923102924102925102926102927102928102929102930102931102932102933102934102935102936102937102938102939102940102941102942102943102944102945102946102947102948102949102950102951102952102953102954102955102956102957102958102959102960102961102962102963102964102965102966102967102968102969102970102971102972102973102974102975102976102977102978102979102980102981102982102983102984102985102986102987102988102989102990102991102992102993102994102995102996102997102998102999103000103001103002103003103004103005103006103007103008103009103010103011103012103013103014103015103016103017103018103019103020103021103022103023103024103025103026103027103028103029103030103031103032103033103034103035103036103037103038103039103040103041103042103043103044103045103046103047103048103049103050103051103052103053103054103055103056103057103058103059103060103061103062103063103064103065103066103067103068103069103070103071103072103073103074103075103076103077103078103079103080103081103082103083103084103085103086103087103088103089103090103091103092103093103094103095103096103097103098103099103100103101103102103103103104103105103106103107103108103109103110103111103112103113103114103115103116103117103118103119103120103121103122103123103124103125103126103127103128103129103130103131103132103133103134103135103136103137103138103139103140103141103142103143103144103145103146103147103148103149103150103151103152103153103154103155103156103157103158103159103160103161103162103163103164103165103166103167103168103169103170103171103172103173103174103175103176103177103178103179103180103181103182103183103184103185103186103187103188103189103190103191103192103193103194103195103196103197103198103199103200103201103202103203103204103205103206103207103208103209103210103211103212103213103214103215103216103217103218103219103220103221103222103223103224103225103226103227103228103229103230103231103232103233103234103235103236103237103238103239103240103241103242103243103244103245103246103247103248103249103250103251103252103253103254103255103256103257103258103259103260103261103262103263103264103265103266103267103268103269103270103271103272103273103274103275103276103277103278103279103280103281103282103283103284103285103286103287103288103289103290103291103292103293103294103295103296103297103298103299103300103301103302103303103304103305103306103307103308103309103310103311103312103313103314103315103316103317103318103319103320103321103322103323103324103325103326103327103328103329103330103331103332103333103334103335103336103337103338103339103340103341103342103343103344103345103346103347103348103349103350103351103352103353103354103355103356103357103358103359103360103361103362103363103364103365103366103367103368103369103370103371103372103373103374103375103376103377103378103379103380103381103382103383103384103385103386103387103388103389103390103391103392103393103394103395103396103397103398103399103400103401103402103403103404103405103406103407103408103409103410103411103412103413103414103415103416103417103418103419103420103421103422103423103424103425103426103427103428103429103430103431103432103433103434103435103436103437103438103439103440103441103442103443103444103445103446103447103448103449103450103451103452103453103454103455103456103457103458103459103460103461103462103463103464103465103466103467103468103469103470103471103472103473103474103475103476103477103478103479103480103481103482103483103484103485103486103487103488103489103490103491103492103493103494103495103496103497103498103499103500103501103502103503103504103505103506103507103508103509103510103511103512103513103514103515103516103517103518103519103520103521103522103523103524103525103526103527103528103529103530103531103532103533103534103535103536103537103538103539103540103541103542103543103544103545103546103547103548103549103550103551103552103553103554103555103556103557103558103559103560103561103562103563103564103565103566103567103568103569103570103571103572103573103574103575103576103577103578103579103580103581103582103583103584103585103586103587103588103589103590103591103592103593103594103595103596103597103598103599103600103601103602103603103604103605103606103607103608103609103610103611103612103613103614103615103616103617103618103619103620103621103622103623103624103625103626103627103628103629103630103631103632103633103634103635103636103637103638103639103640103641103642103643103644103645103646103647103648103649103650103651103652103653103654103655103656103657103658103659103660103661103662103663103664103665103666103667103668103669103670103671103672103673103674103675103676103677103678103679103680103681103682103683103684103685103686103687103688103689103690103691103692103693103694103695103696103697103698103699103700103701103702103703103704103705103706103707103708103709103710103711103712103713103714103715103716103717103718103719103720103721103722103723103724103725103726103727103728103729103730103731103732103733103734103735103736103737103738103739103740103741103742103743103744103745103746103747103748103749103750103751103752103753103754103755103756103757103758103759103760103761103762103763103764103765103766103767103768103769103770103771103772103773103774103775103776103777103778103779103780103781103782103783103784103785103786103787103788103789103790103791103792103793103794103795103796103797103798103799103800103801103802103803103804103805103806103807103808103809103810103811103812103813103814103815103816103817103818103819103820103821103822103823103824103825103826103827103828103829103830103831103832103833103834103835103836103837103838103839103840103841103842103843103844103845103846103847103848103849103850103851103852103853103854103855103856103857103858103859103860103861103862103863103864103865103866103867103868103869103870103871103872103873103874103875103876103877103878103879103880103881103882103883103884103885103886103887103888103889103890103891103892103893103894103895103896103897103898103899103900103901103902103903103904103905103906103907103908103909103910103911103912103913103914103915103916103917103918103919103920103921103922103923103924103925103926103927103928103929103930103931103932103933103934103935103936103937103938103939103940103941103942103943103944103945103946103947103948103949103950103951103952103953103954103955103956103957103958103959103960103961103962103963103964103965103966103967103968103969103970103971103972103973103974103975103976103977103978103979103980103981103982103983103984103985103986103987103988103989103990103991103992103993103994103995103996103997103998103999104000104001104002104003104004104005104006104007104008104009104010104011104012104013104014104015104016104017104018104019104020104021104022104023104024104025104026104027104028104029104030104031104032104033104034104035104036104037104038104039104040104041104042104043104044104045104046104047104048104049104050104051104052104053104054104055104056104057104058104059104060104061104062104063104064104065104066104067104068104069104070104071104072104073104074104075104076104077104078104079104080104081104082104083104084104085104086104087104088104089104090104091104092104093104094104095104096104097104098104099104100104101104102104103104104104105104106104107104108104109104110104111104112104113104114104115104116104117104118104119104120104121104122104123104124104125104126104127104128104129104130104131104132104133104134104135104136104137104138104139104140104141104142104143104144104145104146104147104148104149104150104151104152104153104154104155104156104157104158104159104160104161104162104163104164104165104166104167104168104169104170104171104172104173104174104175104176104177104178104179104180104181104182104183104184104185104186104187104188104189104190104191104192104193104194104195104196104197104198104199104200104201104202104203104204104205104206104207104208104209104210104211104212104213104214104215104216104217104218104219104220104221104222104223104224104225104226104227104228104229104230104231104232104233104234104235104236104237104238104239104240104241104242104243104244104245104246104247104248104249104250104251104252104253104254104255104256104257104258104259104260104261104262104263104264104265104266104267104268104269104270104271104272104273104274104275104276104277104278104279104280104281104282104283104284104285104286104287104288104289104290104291104292104293104294104295104296104297104298104299104300104301104302104303104304104305104306104307104308104309104310104311104312104313104314104315104316104317104318104319104320104321104322104323104324104325104326104327104328104329104330104331104332104333104334104335104336104337104338104339104340104341104342104343104344104345104346104347104348104349104350104351104352104353104354104355104356104357104358104359104360104361104362104363104364104365104366104367104368104369104370104371104372104373104374104375104376104377104378104379104380104381104382104383104384104385104386104387104388104389104390104391104392104393104394104395104396104397104398104399104400104401104402104403104404104405104406104407104408104409104410104411104412104413104414104415104416104417104418104419104420104421104422104423104424104425104426104427104428104429104430104431104432104433104434104435104436104437104438104439104440104441104442104443104444104445104446104447104448104449104450104451104452104453104454104455104456104457104458104459104460104461104462104463104464104465104466104467104468104469104470104471104472104473104474104475104476104477104478104479104480104481104482104483104484104485104486104487104488104489104490104491104492104493104494104495104496104497104498104499104500104501104502104503104504104505104506104507104508104509104510104511104512104513104514104515104516104517104518104519104520104521104522104523104524104525104526104527104528104529104530104531104532104533104534104535104536104537104538104539104540104541104542104543104544104545104546104547104548104549104550104551104552104553104554104555104556104557104558104559104560104561104562104563104564104565104566104567104568104569104570104571104572104573104574104575104576104577104578104579104580104581104582104583104584104585104586104587104588104589104590104591104592104593104594104595104596104597104598104599104600104601104602104603104604104605104606104607104608104609104610104611104612104613104614104615104616104617104618104619104620104621104622104623104624104625104626104627104628104629104630104631104632104633104634104635104636104637104638104639104640104641104642104643104644104645104646104647104648104649104650104651104652104653104654104655104656104657104658104659104660104661104662104663104664104665104666104667104668104669104670104671104672104673104674104675104676104677104678104679104680104681104682104683104684104685104686104687104688104689104690104691104692104693104694104695104696104697104698104699104700104701104702104703104704104705104706104707104708104709104710104711104712104713104714104715104716104717104718104719104720104721104722104723104724104725104726104727104728104729104730104731104732104733104734104735104736104737104738104739104740104741104742104743104744104745104746104747104748104749104750104751104752104753104754104755104756104757104758104759104760104761104762104763104764104765104766104767104768104769104770104771104772104773104774104775104776104777104778104779104780104781104782104783104784104785104786104787104788104789104790104791104792104793104794104795104796104797104798104799104800104801104802104803104804104805104806104807104808104809104810104811104812104813104814104815104816104817104818104819104820104821104822104823104824104825104826104827104828104829104830104831104832104833104834104835104836104837104838104839104840104841104842104843104844104845104846104847104848104849104850104851104852104853104854104855104856104857104858104859104860104861104862104863104864104865104866104867104868104869104870104871104872104873104874104875104876104877104878104879104880104881104882104883104884104885104886104887104888104889104890104891104892104893104894104895104896104897104898104899104900104901104902104903104904104905104906104907104908104909104910104911104912104913104914104915104916104917104918104919104920104921104922104923104924104925104926104927104928104929104930104931104932104933104934104935104936104937104938104939104940104941104942104943104944104945104946104947104948104949104950104951104952104953104954104955104956104957104958104959104960104961104962104963104964104965104966104967104968104969104970104971104972104973104974104975104976104977104978104979104980104981104982104983104984104985104986104987104988104989104990104991104992104993104994104995104996104997104998104999105000105001105002105003105004105005105006105007105008105009105010105011105012105013105014105015105016105017105018105019105020105021105022105023105024105025105026105027105028105029105030105031105032105033105034105035105036105037105038105039105040105041105042105043105044105045105046105047105048105049105050105051105052105053105054105055105056105057105058105059105060105061105062105063105064105065105066105067105068105069105070105071105072105073105074105075105076105077105078105079105080105081105082105083105084105085105086105087105088105089105090105091105092105093105094105095105096105097105098105099105100105101105102105103105104105105105106105107105108105109105110105111105112105113105114105115105116105117105118105119105120105121105122105123105124105125105126105127105128105129105130105131105132105133105134105135105136105137105138105139105140105141105142105143105144105145105146105147105148105149105150105151105152105153105154105155105156105157105158105159105160105161105162105163105164105165105166105167105168105169105170105171105172105173105174105175105176105177105178105179105180105181105182105183105184105185105186105187105188105189105190105191105192105193105194105195105196105197105198105199105200105201105202105203105204105205105206105207105208105209105210105211105212105213105214105215105216105217105218105219105220105221105222105223105224105225105226105227105228105229105230105231105232105233105234105235105236105237105238105239105240105241105242105243105244105245105246105247105248105249105250105251105252105253105254105255105256105257105258105259105260105261105262105263105264105265105266105267105268105269105270105271105272105273105274105275105276105277105278105279105280105281105282105283105284105285105286105287105288105289105290105291105292105293105294105295105296105297105298105299105300105301105302105303105304105305105306105307105308105309105310105311105312105313105314105315105316105317105318105319105320105321105322105323105324105325105326105327105328105329105330105331105332105333105334105335105336105337105338105339105340105341105342105343105344105345105346105347105348105349105350105351105352105353105354105355105356105357105358105359105360105361105362105363105364105365105366105367105368105369105370105371105372105373105374105375105376105377105378105379105380105381105382105383105384105385105386105387105388105389105390105391105392105393105394105395105396105397105398105399105400105401105402105403105404105405105406105407105408105409105410105411105412105413105414105415105416105417105418105419105420105421105422105423105424105425105426105427105428105429105430105431105432105433105434105435105436105437105438105439105440105441105442105443105444105445105446105447105448105449105450105451105452105453105454105455105456105457105458105459105460105461105462105463105464105465105466105467105468105469105470105471105472105473105474105475105476105477105478105479105480105481105482105483105484105485105486105487105488105489105490105491105492105493105494105495105496105497105498105499105500105501105502105503105504105505105506105507105508105509105510105511105512105513105514105515105516105517105518105519105520105521105522105523105524105525105526105527105528105529105530105531105532105533105534105535105536105537105538105539105540105541105542105543105544105545105546105547105548105549105550105551105552105553105554105555105556105557105558105559105560105561105562105563105564105565105566105567105568105569105570105571105572105573105574105575105576105577105578105579105580105581105582105583105584105585105586105587105588105589105590105591105592105593105594105595105596105597105598105599105600105601105602105603105604105605105606105607105608105609105610105611105612105613105614105615105616105617105618105619105620105621105622105623105624105625105626105627105628105629105630105631105632105633105634105635105636105637105638105639105640105641105642105643105644105645105646105647105648105649105650105651105652105653105654105655105656105657105658105659105660105661105662105663105664105665105666105667105668105669105670105671105672105673105674105675105676105677105678105679105680105681105682105683105684105685105686105687105688105689105690105691105692105693105694105695105696105697105698105699105700105701105702105703105704105705105706105707105708105709105710105711105712105713105714105715105716105717105718105719105720105721105722105723105724105725105726105727105728105729105730105731105732105733105734105735105736105737105738105739105740105741105742105743105744105745105746105747105748105749105750105751105752105753105754105755105756105757105758105759105760105761105762105763105764105765105766105767105768105769105770105771105772105773105774105775105776105777105778105779105780105781105782105783105784105785105786105787105788105789105790105791105792105793105794105795105796105797105798105799105800105801105802105803105804105805105806105807105808105809105810105811105812105813105814105815105816105817105818105819105820105821105822105823105824105825105826105827105828105829105830105831105832105833105834105835105836105837105838105839105840105841105842105843105844105845105846105847105848105849105850105851105852105853105854105855105856105857105858105859105860105861105862105863105864105865105866105867105868105869105870105871105872105873105874105875105876105877105878105879105880105881105882105883105884105885105886105887105888105889105890105891105892105893105894105895105896105897105898105899105900105901105902105903105904105905105906105907105908105909105910105911105912105913105914105915105916105917105918105919105920105921105922105923105924105925105926105927105928105929105930105931105932105933105934105935105936105937105938105939105940105941105942105943105944105945105946105947105948105949105950105951105952105953105954105955105956105957105958105959105960105961105962105963105964105965105966105967105968105969105970105971105972105973105974105975105976105977105978105979105980105981105982105983105984105985105986105987105988105989105990105991105992105993105994105995105996105997105998105999106000106001106002106003106004106005106006106007106008106009106010106011106012106013106014106015106016106017106018106019106020106021106022106023106024106025106026106027106028106029106030106031106032106033106034106035106036106037106038106039106040106041106042106043106044106045106046106047106048106049106050106051106052106053106054106055106056106057106058106059106060106061106062106063106064106065106066106067106068106069106070106071106072106073106074106075106076106077106078106079106080106081106082106083106084106085106086106087106088106089106090106091106092106093106094106095106096106097106098106099106100106101106102106103106104106105106106106107106108106109106110106111106112106113106114106115106116106117106118106119106120106121106122106123106124106125106126106127106128106129106130106131106132106133106134106135106136106137106138106139106140106141106142106143106144106145106146106147106148106149106150106151106152106153106154106155106156106157106158106159106160106161106162106163106164106165106166106167106168106169106170106171106172106173106174106175106176106177106178106179106180106181106182106183106184106185106186106187106188106189106190106191106192106193106194106195106196106197106198106199106200106201106202106203106204106205106206106207106208106209106210106211106212106213106214106215106216106217106218106219106220106221106222106223106224106225106226106227106228106229106230106231106232106233106234106235106236106237106238106239106240106241106242106243106244106245106246106247106248106249106250106251106252106253106254106255106256106257106258106259106260106261106262106263106264106265106266106267106268106269106270106271106272106273106274106275106276106277106278106279106280106281106282106283106284106285106286106287106288106289106290106291106292106293106294106295106296106297106298106299106300106301106302106303106304106305106306106307106308106309106310106311106312106313106314106315106316106317106318106319106320106321106322106323106324106325106326106327106328106329106330106331106332106333106334106335106336106337106338106339106340106341106342106343106344106345106346106347106348106349106350106351106352106353106354106355106356106357106358106359106360106361106362106363106364106365106366106367106368106369106370106371106372106373106374106375106376106377106378106379106380106381106382106383106384106385106386106387106388106389106390106391106392106393106394106395106396106397106398106399106400106401106402106403106404106405106406106407106408106409106410106411106412106413106414106415106416106417106418106419106420106421106422106423106424106425106426106427106428106429106430106431106432106433106434106435106436106437106438106439106440106441106442106443106444106445106446106447106448106449106450106451106452106453106454106455106456106457106458106459106460106461106462106463106464106465106466106467106468106469106470106471106472106473106474106475106476106477106478106479106480106481106482106483106484106485106486106487106488106489106490106491106492106493106494106495106496106497106498106499106500106501106502106503106504106505106506106507106508106509106510106511106512106513106514106515106516106517106518106519106520106521106522106523106524106525106526106527106528106529106530106531106532106533106534106535106536106537106538106539106540106541106542106543106544106545106546106547106548106549106550106551106552106553106554106555106556106557106558106559106560106561106562106563106564106565106566106567106568106569106570106571106572106573106574106575106576106577106578106579106580106581106582106583106584106585106586106587106588106589106590106591106592106593106594106595106596106597106598106599106600106601106602106603106604106605106606106607106608106609106610106611106612106613106614106615106616106617106618106619106620106621106622106623106624106625106626106627106628106629106630106631106632106633106634106635106636106637106638106639106640106641106642106643106644106645106646106647106648106649106650106651106652106653106654106655106656106657106658106659106660106661106662106663106664106665106666106667106668106669106670106671106672106673106674106675106676106677106678106679106680106681106682106683106684106685106686106687106688106689106690106691106692106693106694106695106696106697106698106699106700106701106702106703106704106705106706106707106708106709106710106711106712106713106714106715106716106717106718106719106720106721106722106723106724106725106726106727106728106729106730106731106732106733106734106735106736106737106738106739106740106741106742106743106744106745106746106747106748106749106750106751106752106753106754106755106756106757106758106759106760106761106762106763106764106765106766106767106768106769106770106771106772106773106774106775106776106777106778106779106780106781106782106783106784106785106786106787106788106789106790106791106792106793106794106795106796106797106798106799106800106801106802106803106804106805106806106807106808106809106810106811106812106813106814106815106816106817106818106819106820106821106822106823106824106825106826106827106828106829106830106831106832106833106834106835106836106837106838106839106840106841106842106843106844106845106846106847106848106849106850106851106852106853106854106855106856106857106858106859106860106861106862106863106864106865106866106867106868106869106870106871106872106873106874106875106876106877106878106879106880106881106882106883106884106885106886106887106888106889106890106891106892106893106894106895106896106897106898106899106900106901106902106903106904106905106906106907106908106909106910106911106912106913106914106915106916106917106918106919106920106921106922106923106924106925106926106927106928106929106930106931106932106933106934106935106936106937106938106939106940106941106942106943106944106945106946106947106948106949106950106951106952106953106954106955106956106957106958106959106960106961106962106963106964106965106966106967106968106969106970106971106972106973106974106975106976106977106978106979106980106981106982106983106984106985106986106987106988106989106990106991106992106993106994106995106996106997106998106999107000107001107002107003107004107005107006107007107008107009107010107011107012107013107014107015107016107017107018107019107020107021107022107023107024107025107026107027107028107029107030107031107032107033107034107035107036107037107038107039107040107041107042107043107044107045107046107047107048107049107050107051107052107053107054107055107056107057107058107059107060107061107062107063107064107065107066107067107068107069107070107071107072107073107074107075107076107077107078107079107080107081107082107083107084107085107086107087107088107089107090107091107092107093107094107095107096107097107098107099107100107101107102107103107104107105107106107107107108107109107110107111107112107113107114107115107116107117107118107119107120107121107122107123107124107125107126107127107128107129107130107131107132107133107134107135107136107137107138107139107140107141107142107143107144107145107146107147107148107149107150107151107152107153107154107155107156107157107158107159107160107161107162107163107164107165107166107167107168107169107170107171107172107173107174107175107176107177107178107179107180107181107182107183107184107185107186107187107188107189107190107191107192107193107194107195107196107197107198107199107200107201107202107203107204107205107206107207107208107209107210107211107212107213107214107215107216107217107218107219107220107221107222107223107224107225107226107227107228107229107230107231107232107233107234107235107236107237107238107239107240107241107242107243107244107245107246107247107248107249107250107251107252107253107254107255107256107257107258107259107260107261107262107263107264107265107266107267107268107269107270107271107272107273107274107275107276107277107278107279107280107281107282107283107284107285107286107287107288107289107290107291107292107293107294107295107296107297107298107299107300107301107302107303107304107305107306107307107308107309107310107311107312107313107314107315107316107317107318107319107320107321107322107323107324107325107326107327107328107329107330107331107332107333107334107335107336107337107338107339107340107341107342107343107344107345107346107347107348107349107350107351107352107353107354107355107356107357107358107359107360107361107362107363107364107365107366107367107368107369107370107371107372107373107374107375107376107377107378107379107380107381107382107383107384107385107386107387107388107389107390107391107392107393107394107395107396107397107398107399107400107401107402107403107404107405107406107407107408107409107410107411107412107413107414107415107416107417107418107419107420107421107422107423107424107425107426107427107428107429107430107431107432107433107434107435107436107437107438107439107440107441107442107443107444107445107446107447107448107449107450107451107452107453107454107455107456107457107458107459107460107461107462107463107464107465107466107467107468107469107470107471107472107473107474107475107476107477107478107479107480107481107482107483107484107485107486107487107488107489107490107491107492107493107494107495107496107497107498107499107500107501107502107503107504107505107506107507107508107509107510107511107512107513107514107515107516107517107518107519107520107521107522107523107524107525107526107527107528107529107530107531107532107533107534107535107536107537107538107539107540107541107542107543107544107545107546107547107548107549107550107551107552107553107554107555107556107557107558107559107560107561107562107563107564107565107566107567107568107569107570107571107572107573107574107575107576107577107578107579107580107581107582107583107584107585107586107587107588107589107590107591107592107593107594107595107596107597107598107599107600107601107602107603107604107605107606107607107608107609107610107611107612107613107614107615107616107617107618107619107620107621107622107623107624107625107626107627107628107629107630107631107632107633107634107635107636107637107638107639107640107641107642107643107644107645107646107647107648107649107650107651107652107653107654107655107656107657107658107659107660107661107662107663107664107665107666107667107668107669107670107671107672107673107674107675107676107677107678107679107680107681107682107683107684107685107686107687107688107689107690107691107692107693107694107695107696107697107698107699107700107701107702107703107704107705107706107707107708107709107710107711107712107713107714107715107716107717107718107719107720107721107722107723107724107725107726107727107728107729107730107731107732107733107734107735107736107737107738107739107740107741107742107743107744107745107746107747107748107749107750107751107752107753107754107755107756107757107758107759107760107761107762107763107764107765107766107767107768107769107770107771107772107773107774107775107776107777107778107779107780107781107782107783107784107785107786107787107788107789107790107791107792107793107794107795107796107797107798107799107800107801107802107803107804107805107806107807107808107809107810107811107812107813107814107815107816107817107818107819107820107821107822107823107824107825107826107827107828107829107830107831107832107833107834107835107836107837107838107839107840107841107842107843107844107845107846107847107848107849107850107851107852107853107854107855107856107857107858107859107860107861107862107863107864107865107866107867107868107869107870107871107872107873107874107875107876107877107878107879107880107881107882107883107884107885107886107887107888107889107890107891107892107893107894107895107896107897107898107899107900107901107902107903107904107905107906107907107908107909107910107911107912107913107914107915107916107917107918107919107920107921107922107923107924107925107926107927107928107929107930107931107932107933107934107935107936107937107938107939107940107941107942107943107944107945107946107947107948107949107950107951107952107953107954107955107956107957107958107959107960107961107962107963107964107965107966107967107968107969107970107971107972107973107974107975107976107977107978107979107980107981107982107983107984107985107986107987107988107989107990107991107992107993107994107995107996107997107998107999108000108001108002108003108004108005108006108007108008108009108010108011108012108013108014108015108016108017108018108019108020108021108022108023108024108025108026108027108028108029108030108031108032108033108034108035108036108037108038108039108040108041108042108043108044108045108046108047108048108049108050108051108052108053108054108055108056108057108058108059108060108061108062108063108064108065108066108067108068108069108070108071108072108073108074108075108076108077108078108079108080108081108082108083108084108085108086108087108088108089108090108091108092108093108094108095108096108097108098108099108100108101108102108103108104108105108106108107108108108109108110108111108112108113108114108115108116108117108118108119108120108121108122108123108124108125108126108127108128108129108130108131108132108133108134108135108136108137108138108139108140108141108142108143108144108145108146108147108148108149108150108151108152108153108154108155108156108157108158108159108160108161108162108163108164108165108166108167108168108169108170108171108172108173108174108175108176108177108178108179108180108181108182108183108184108185108186108187108188108189108190108191108192108193108194108195108196108197108198108199108200108201108202108203108204108205108206108207108208108209108210108211108212108213108214108215108216108217108218108219108220108221108222108223108224108225108226108227108228108229108230108231108232108233108234108235108236108237108238108239108240108241108242108243108244108245108246108247108248108249108250108251108252108253108254108255108256108257108258108259108260108261108262108263108264108265108266108267108268108269108270108271108272108273108274108275108276108277108278108279108280108281108282108283108284108285108286108287108288108289108290108291108292108293108294108295108296108297108298108299108300108301108302108303108304108305108306108307108308108309108310108311108312108313108314108315108316108317108318108319108320108321108322108323108324108325108326108327108328108329108330108331108332108333108334108335108336108337108338108339108340108341108342108343108344108345108346108347108348108349108350108351108352108353108354108355108356108357108358108359108360108361108362108363108364108365108366108367108368108369108370108371108372108373108374108375108376108377108378108379108380108381108382108383108384108385108386108387108388108389108390108391108392108393108394108395108396108397108398108399108400108401108402108403108404108405108406108407108408108409108410108411108412108413108414108415108416108417108418108419108420108421108422108423108424108425108426108427108428108429108430108431108432108433108434108435108436108437108438108439108440108441108442108443108444108445108446108447108448108449108450108451108452108453108454108455108456108457108458108459108460108461108462108463108464108465108466108467108468108469108470108471108472108473108474108475108476108477108478108479108480108481108482108483108484108485108486108487108488108489108490108491108492108493108494108495108496108497108498108499108500108501108502108503108504108505108506108507108508108509108510108511108512108513108514108515108516108517108518108519108520108521108522108523108524108525108526108527108528108529108530108531108532108533108534108535108536108537108538108539108540108541108542108543108544108545108546108547108548108549108550108551108552108553108554108555108556108557108558108559108560108561108562108563108564108565108566108567108568108569108570108571108572108573108574108575108576108577108578108579108580108581108582108583108584108585108586108587108588108589108590108591108592108593108594108595108596108597108598108599108600108601108602108603108604108605108606108607108608108609108610108611108612108613108614108615108616108617108618108619108620108621108622108623108624108625108626108627108628108629108630108631108632108633108634108635108636108637108638108639108640108641108642108643108644108645108646108647108648108649108650108651108652108653108654108655108656108657108658108659108660108661108662108663108664108665108666108667108668108669108670108671108672108673108674108675108676108677108678108679108680108681108682108683108684108685108686108687108688108689108690108691108692108693108694108695108696108697108698108699108700108701108702108703108704108705108706108707108708108709108710108711108712108713108714108715108716108717108718108719108720108721108722108723108724108725108726108727108728108729108730108731108732108733108734108735108736108737108738108739108740108741108742108743108744108745108746108747108748108749108750108751108752108753108754108755108756108757108758108759108760108761108762108763108764108765108766108767108768108769108770108771108772108773108774108775108776108777108778108779108780108781108782108783108784108785108786108787108788108789108790108791108792108793108794108795108796108797108798108799108800108801108802108803108804108805108806108807108808108809108810108811108812108813108814108815108816108817108818108819108820108821108822108823108824108825108826108827108828108829108830108831108832108833108834108835108836108837108838108839108840108841108842108843108844108845108846108847108848108849108850108851108852108853108854108855108856108857108858108859108860108861108862108863108864108865108866108867108868108869108870108871108872108873108874108875108876108877108878108879108880108881108882108883108884108885108886108887108888108889108890108891108892108893108894108895108896108897108898108899108900108901108902108903108904108905108906108907108908108909108910108911108912108913108914108915108916108917108918108919108920108921108922108923108924108925108926108927108928108929108930108931108932108933108934108935108936108937108938108939108940108941108942108943108944108945108946108947108948108949108950108951108952108953108954108955108956108957108958108959108960108961108962108963108964108965108966108967108968108969108970108971108972108973108974108975108976108977108978108979108980108981108982108983108984108985108986108987108988108989108990108991108992108993108994108995108996108997108998108999109000109001109002109003109004109005109006109007109008109009109010109011109012109013109014109015109016109017109018109019109020109021109022109023109024109025109026109027109028109029109030109031109032109033109034109035109036109037109038109039109040109041109042109043109044109045109046109047109048109049109050109051109052109053109054109055109056109057109058109059109060109061109062109063109064109065109066109067109068109069109070109071109072109073109074109075109076109077109078109079109080109081109082109083109084109085109086109087109088109089109090109091109092109093109094109095109096109097109098109099109100109101109102109103109104109105109106109107109108109109109110109111109112109113109114109115109116109117109118109119109120109121109122109123109124109125109126109127109128109129109130109131109132109133109134109135109136109137109138109139109140109141109142109143109144109145109146109147109148109149109150109151109152109153109154109155109156109157109158109159109160109161109162109163109164109165109166109167109168109169109170109171109172109173109174109175109176109177109178109179109180109181109182109183109184109185109186109187109188109189109190109191109192109193109194109195109196109197109198109199109200109201109202109203109204109205109206109207109208109209109210109211109212109213109214109215109216109217109218109219109220109221109222109223109224109225109226109227109228109229109230109231109232109233109234109235109236109237109238109239109240109241109242109243109244109245109246109247109248109249109250109251109252109253109254109255109256109257109258109259109260109261109262109263109264109265109266109267109268109269109270109271109272109273109274109275109276109277109278109279109280109281109282109283109284109285109286109287109288109289109290109291109292109293109294109295109296109297109298109299109300109301109302109303109304109305109306109307109308109309109310109311109312109313109314109315109316109317109318109319109320109321109322109323109324109325109326109327109328109329109330109331109332109333109334109335109336109337109338109339109340109341109342109343109344109345109346109347109348109349109350109351109352109353109354109355109356109357109358109359109360109361109362109363109364109365109366109367109368109369109370109371109372109373109374109375109376109377109378109379109380109381109382109383109384109385109386109387109388109389109390109391109392109393109394109395109396109397109398109399109400109401109402109403109404109405109406109407109408109409109410109411109412109413109414109415109416109417109418109419109420109421109422109423109424109425109426109427109428109429109430109431109432109433109434109435109436109437109438109439109440109441109442109443109444109445109446109447109448109449109450109451109452109453109454109455109456109457109458109459109460109461109462109463109464109465109466109467109468109469109470109471109472109473109474109475109476109477109478109479109480109481109482109483109484109485109486109487109488109489109490109491109492109493109494109495109496109497109498109499109500109501109502109503109504109505109506109507109508109509109510109511109512109513109514109515109516109517109518109519109520109521109522109523109524109525109526109527109528109529109530109531109532109533109534109535109536109537109538109539109540109541109542109543109544109545109546109547109548109549109550109551109552109553109554109555109556109557109558109559109560109561109562109563109564109565109566109567109568109569109570109571109572109573109574109575109576109577109578109579109580109581109582109583109584109585109586109587109588109589109590109591109592109593109594109595109596109597109598109599109600109601109602109603109604109605109606109607109608109609109610109611109612109613109614109615109616109617109618109619109620109621109622109623109624109625109626109627109628109629109630109631109632109633109634109635109636109637109638109639109640109641109642109643109644109645109646109647109648109649109650109651109652109653109654109655109656109657109658109659109660109661109662109663109664109665109666109667109668109669109670109671109672109673109674109675109676109677109678109679109680109681109682109683109684109685109686109687109688109689109690109691109692109693109694109695109696109697109698109699109700109701109702109703109704109705109706109707109708109709109710109711109712109713109714109715109716109717109718109719109720109721109722109723109724109725109726109727109728109729109730109731109732109733109734109735109736109737109738109739109740109741109742109743109744109745109746109747109748109749109750109751109752109753109754109755109756109757109758109759109760109761109762109763109764109765109766109767109768109769109770109771109772109773109774109775109776109777109778109779109780109781109782109783109784109785109786109787109788109789109790109791109792109793109794109795109796109797109798109799109800109801109802109803109804109805109806109807109808109809109810109811109812109813109814109815109816109817109818109819109820109821109822109823109824109825109826109827109828109829109830109831109832109833109834109835109836109837109838109839109840109841109842109843109844109845109846109847109848109849109850109851109852109853109854109855109856109857109858109859109860109861109862109863109864109865109866109867109868109869109870109871109872109873109874109875109876109877109878109879109880109881109882109883109884109885109886109887109888109889109890109891109892109893109894109895109896109897109898109899109900109901109902109903109904109905109906109907109908109909109910109911109912109913109914109915109916109917109918109919109920109921109922109923109924109925109926109927109928109929109930109931109932109933109934109935109936109937109938109939109940109941109942109943109944109945109946109947109948109949109950109951109952109953109954109955109956109957109958109959109960109961109962109963109964109965109966109967109968109969109970109971109972109973109974109975109976109977109978109979109980109981109982109983109984109985109986109987109988109989109990109991109992109993109994109995109996109997109998109999110000110001110002110003110004110005110006110007110008110009110010110011110012110013110014110015110016110017110018110019110020110021110022110023110024110025110026110027110028110029110030110031110032110033110034110035110036110037110038110039110040110041110042110043110044110045110046110047110048110049110050110051110052110053110054110055110056110057110058110059110060110061110062110063110064110065110066110067110068110069110070110071110072110073110074110075110076110077110078110079110080110081110082110083110084110085110086110087110088110089110090110091110092110093110094110095110096110097110098110099110100110101110102110103110104110105110106110107110108110109110110110111110112110113110114110115110116110117110118110119110120110121110122110123110124110125110126110127110128110129110130110131110132110133110134110135110136110137110138110139110140110141110142110143110144110145110146110147110148110149110150110151110152110153110154110155110156110157110158110159110160110161110162110163110164110165110166110167110168110169110170110171110172110173110174110175110176110177110178110179110180110181110182110183110184110185110186110187110188110189110190110191110192110193110194110195110196110197110198110199110200110201110202110203110204110205110206110207110208110209110210110211110212110213110214110215110216110217110218110219110220110221110222110223110224110225110226110227110228110229110230110231110232110233110234110235110236110237110238110239110240110241110242110243110244110245110246110247110248110249110250110251110252110253110254110255110256110257110258110259110260110261110262110263110264110265110266110267110268110269110270110271110272110273110274110275110276110277110278110279110280110281110282110283110284110285110286110287110288110289110290110291110292110293110294110295110296110297110298110299110300110301110302110303110304110305110306110307110308110309110310110311110312110313110314110315110316110317110318110319110320110321110322110323110324110325110326110327110328110329110330110331110332110333110334110335110336110337110338110339110340110341110342110343110344110345110346110347110348110349110350110351110352110353110354110355110356110357110358110359110360110361110362110363110364110365110366110367110368110369110370110371110372110373110374110375110376110377110378110379110380110381110382110383110384110385110386110387110388110389110390110391110392110393110394110395110396110397110398110399110400110401110402110403110404110405110406110407110408110409110410110411110412110413110414110415110416110417110418110419110420110421110422110423110424110425110426110427110428110429110430110431110432110433110434110435110436110437110438110439110440110441110442110443110444110445110446110447110448110449110450110451110452110453110454110455110456110457110458110459110460110461110462110463110464110465110466110467110468110469110470110471110472110473110474110475110476110477110478110479110480110481110482110483110484110485110486110487110488110489110490110491110492110493110494110495110496110497110498110499110500110501110502110503110504110505110506110507110508110509110510110511110512110513110514110515110516110517110518110519110520110521110522110523110524110525110526110527110528110529110530110531110532110533110534110535110536110537110538110539110540110541110542110543110544110545110546110547110548110549110550110551110552110553110554110555110556110557110558110559110560110561110562110563110564110565110566110567110568110569110570110571110572110573110574110575110576110577110578110579110580110581110582110583110584110585110586110587110588110589110590110591110592110593110594110595110596110597110598110599110600110601110602110603110604110605110606110607110608110609110610110611110612110613110614110615110616110617110618110619110620110621110622110623110624110625110626110627110628110629110630110631110632110633110634110635110636110637110638110639110640110641110642110643110644110645110646110647110648110649110650110651110652110653110654110655110656110657110658110659110660110661110662110663110664110665110666110667110668110669110670110671110672110673110674110675110676110677110678110679110680110681110682110683110684110685110686110687110688110689110690110691110692110693110694110695110696110697110698110699110700110701110702110703110704110705110706110707110708110709110710110711110712110713110714110715110716110717110718110719110720110721110722110723110724110725110726110727110728110729110730110731110732110733110734110735110736110737110738110739110740110741110742110743110744110745110746110747110748110749110750110751110752110753110754110755110756110757110758110759110760110761110762110763110764110765110766110767110768110769110770110771110772110773110774110775110776110777110778110779110780110781110782110783110784110785110786110787110788110789110790110791110792110793110794110795110796110797110798110799110800110801110802110803110804110805110806110807110808110809110810110811110812110813110814110815110816110817110818110819110820110821110822110823110824110825110826110827110828110829110830110831110832110833110834110835110836110837110838110839110840110841110842110843110844110845110846110847110848110849110850110851110852110853110854110855110856110857110858110859110860110861110862110863110864110865110866110867110868110869110870110871110872110873110874110875110876110877110878110879110880110881110882110883110884110885110886110887110888110889110890110891110892110893110894110895110896110897110898110899110900110901110902110903110904110905110906110907110908110909110910110911110912110913110914110915110916110917110918110919110920110921110922110923110924110925110926110927110928110929110930110931110932110933110934110935110936110937110938110939110940110941110942110943110944110945110946110947110948110949110950110951110952110953110954110955110956110957110958110959110960110961110962110963110964110965110966110967110968110969110970110971110972110973110974110975110976110977110978110979110980110981110982110983110984110985110986110987110988110989110990110991110992110993110994110995110996110997110998110999111000111001111002111003111004111005111006111007111008111009111010111011111012111013111014111015111016111017111018111019111020111021111022111023111024111025111026111027111028111029111030111031111032111033111034111035111036111037111038111039111040111041111042111043111044111045111046111047111048111049111050111051111052111053111054111055111056111057111058111059111060111061111062111063111064111065111066111067111068111069111070111071111072111073111074111075111076111077111078111079111080111081111082111083111084111085111086111087111088111089111090111091111092111093111094111095111096111097111098111099111100111101111102111103111104111105111106111107111108111109111110111111111112111113111114111115111116111117111118111119111120111121111122111123111124111125111126111127111128111129111130111131111132111133111134111135111136111137111138111139111140111141111142111143111144111145111146111147111148111149111150111151111152111153111154111155111156111157111158111159111160111161111162111163111164111165111166111167111168111169111170111171111172111173111174111175111176111177111178111179111180111181111182111183111184111185111186111187111188111189111190111191111192111193111194111195111196111197111198111199111200111201111202111203111204111205111206111207111208111209111210111211111212111213111214111215111216111217111218111219111220111221111222111223111224111225111226111227111228111229111230111231111232111233111234111235111236111237111238111239111240111241111242111243111244111245111246111247111248111249111250111251111252111253111254111255111256111257111258111259111260111261111262111263111264111265111266111267111268111269111270111271111272111273111274111275111276111277111278111279111280111281111282111283111284111285111286111287111288111289111290111291111292111293111294111295111296111297111298111299111300111301111302111303111304111305111306111307111308111309111310111311111312111313111314111315111316111317111318111319111320111321111322111323111324111325111326111327111328111329111330111331111332111333111334111335111336111337111338111339111340111341111342111343111344111345111346111347111348111349111350111351111352111353111354111355111356111357111358111359111360111361111362111363111364111365111366111367111368111369111370111371111372111373111374111375111376111377111378111379111380111381111382111383111384111385111386111387111388111389111390111391111392111393111394111395111396111397111398111399111400111401111402111403111404111405111406111407111408111409111410111411111412111413111414111415111416111417111418111419111420111421111422111423111424111425111426111427111428111429111430111431111432111433111434111435111436111437111438111439111440111441111442111443111444111445111446111447111448111449111450111451111452111453111454111455111456111457111458111459111460111461111462111463111464111465111466111467111468111469111470111471111472111473111474111475111476111477111478111479111480111481111482111483111484111485111486111487111488111489111490111491111492111493111494111495111496111497111498111499111500111501111502111503111504111505111506111507111508111509111510111511111512111513111514111515111516111517111518111519111520111521111522111523111524111525111526111527111528111529111530111531111532111533111534111535111536111537111538111539111540111541111542111543111544111545111546111547111548111549111550111551111552111553111554111555111556111557111558111559111560111561111562111563111564111565111566111567111568111569111570111571111572111573111574111575111576111577111578111579111580111581111582111583111584111585111586111587111588111589111590111591111592111593111594111595111596111597111598111599111600111601111602111603111604111605111606111607111608111609111610111611111612111613111614111615111616111617111618111619111620111621111622111623111624111625111626111627111628111629111630111631111632111633111634111635111636111637111638111639111640111641111642111643111644111645111646111647111648111649111650111651111652111653111654111655111656111657111658111659111660111661111662111663111664111665111666111667111668111669111670111671111672111673111674111675111676111677111678111679111680111681111682111683111684111685111686111687111688111689111690111691111692111693111694111695111696111697111698111699111700111701111702111703111704111705111706111707111708111709111710111711111712111713111714111715111716111717111718111719111720111721111722111723111724111725111726111727111728111729111730111731111732111733111734111735111736111737111738111739111740111741111742111743111744111745111746111747111748111749111750111751111752111753111754111755111756111757111758111759111760111761111762111763111764111765111766111767111768111769111770111771111772111773111774111775111776111777111778111779111780111781111782111783111784111785111786111787111788111789111790111791111792111793111794111795111796111797111798111799111800111801111802111803111804111805111806111807111808111809111810111811111812111813111814111815111816111817111818111819111820111821111822111823111824111825111826111827111828111829111830111831111832111833111834111835111836111837111838111839111840111841111842111843111844111845111846111847111848111849111850111851111852111853111854111855111856111857111858111859111860111861111862111863111864111865111866111867111868111869111870111871111872111873111874111875111876111877111878111879111880111881111882111883111884111885111886111887111888111889111890111891111892111893111894111895111896111897111898111899111900111901111902111903111904111905111906111907111908111909111910111911111912111913111914111915111916111917111918111919111920111921111922111923111924111925111926111927111928111929111930111931111932111933111934111935111936111937111938111939111940111941111942111943111944111945111946111947111948111949111950111951111952111953111954111955111956111957111958111959111960111961111962111963111964111965111966111967111968111969111970111971111972111973111974111975111976111977111978111979111980111981111982111983111984111985111986111987111988111989111990111991111992111993111994111995111996111997111998111999112000112001112002112003112004112005112006112007112008112009112010112011112012112013112014112015112016112017112018112019112020112021112022112023112024112025112026112027112028112029112030112031112032112033112034112035112036112037112038112039112040112041112042112043112044112045112046112047112048112049112050112051112052112053112054112055112056112057112058112059112060112061112062112063112064112065112066112067112068112069112070112071112072112073112074112075112076112077112078112079112080112081112082112083112084112085112086112087112088112089112090112091112092112093112094112095112096112097112098112099112100112101112102112103112104112105112106112107112108112109112110112111112112112113112114112115112116112117112118112119112120112121112122112123112124112125112126112127112128112129112130112131112132112133112134112135112136112137112138112139112140112141112142112143112144112145112146112147112148112149112150112151112152112153112154112155112156112157112158112159112160112161112162112163112164112165112166112167112168112169112170112171112172112173112174112175112176112177112178112179112180112181112182112183112184112185112186112187112188112189112190112191112192112193112194112195112196112197112198112199112200112201112202112203112204112205112206112207112208112209112210112211112212112213112214112215112216112217112218112219112220112221112222112223112224112225112226112227112228112229112230112231112232112233112234112235112236112237112238112239112240112241112242112243112244112245112246112247112248112249112250112251112252112253112254112255112256112257112258112259112260112261112262112263112264112265112266112267112268112269112270112271112272112273112274112275112276112277112278112279112280112281112282112283112284112285112286112287112288112289112290112291112292112293112294112295112296112297112298112299112300112301112302112303112304112305112306112307112308112309112310112311112312112313112314112315112316112317112318112319112320112321112322112323112324112325112326112327112328112329112330112331112332112333112334112335112336112337112338112339112340112341112342112343112344112345112346112347112348112349112350112351112352112353112354112355112356112357112358112359112360112361112362112363112364112365112366112367112368112369112370112371112372112373112374112375112376112377112378112379112380112381112382112383112384112385112386112387112388112389112390112391112392112393112394112395112396112397112398112399112400112401112402112403112404112405112406112407112408112409112410112411112412112413112414112415112416112417112418112419112420112421112422112423112424112425112426112427112428112429112430112431112432112433112434112435112436112437112438112439112440112441112442112443112444112445112446112447112448112449112450112451112452112453112454112455112456112457112458112459112460112461112462112463112464112465112466112467112468112469112470112471112472112473112474112475112476112477112478112479112480112481112482112483112484112485112486112487112488112489112490112491112492112493112494112495112496112497112498112499112500112501112502112503112504112505112506112507112508112509112510112511112512112513112514112515112516112517112518112519112520112521112522112523112524112525112526112527112528112529112530112531112532112533112534112535112536112537112538112539112540112541112542112543112544112545112546112547112548112549112550112551112552112553112554112555112556112557112558112559112560112561112562112563112564112565112566112567112568112569112570112571112572112573112574112575112576112577112578112579112580112581112582112583112584112585112586112587112588112589112590112591112592112593112594112595112596112597112598112599112600112601112602112603112604112605112606112607112608112609112610112611112612112613112614112615112616112617112618112619112620112621112622112623112624112625112626112627112628112629112630112631112632112633112634112635112636112637112638112639112640112641112642112643112644112645112646112647112648112649112650112651112652112653112654112655112656112657112658112659112660112661112662112663112664112665112666112667112668112669112670112671112672112673112674112675112676112677112678112679112680112681112682112683112684112685112686112687112688112689112690112691112692112693112694112695112696112697112698112699112700112701112702112703112704112705112706112707112708112709112710112711112712112713112714112715112716112717112718112719112720112721112722112723112724112725112726112727112728112729112730112731112732112733112734112735112736112737112738112739112740112741112742112743112744112745112746112747112748112749112750112751112752112753112754112755112756112757112758112759112760112761112762112763112764112765112766112767112768112769112770112771112772112773112774112775112776112777112778112779112780112781112782112783112784112785112786112787112788112789112790112791112792112793112794112795112796112797112798112799112800112801112802112803112804112805112806112807112808112809112810112811112812112813112814112815112816112817112818112819112820112821112822112823112824112825112826112827112828112829112830112831112832112833112834112835112836112837112838112839112840112841112842112843112844112845112846112847112848112849112850112851112852112853112854112855112856112857112858112859112860112861112862112863112864112865112866112867112868112869112870112871112872112873112874112875112876112877112878112879112880112881112882112883112884112885112886112887112888112889112890112891112892112893112894112895112896112897112898112899112900112901112902112903112904112905112906112907112908112909112910112911112912112913112914112915112916112917112918112919112920112921112922112923112924112925112926112927112928112929112930112931112932112933112934112935112936112937112938112939112940112941112942112943112944112945112946112947112948112949112950112951112952112953112954112955112956112957112958112959112960112961112962112963112964112965112966112967112968112969112970112971112972112973112974112975112976112977112978112979112980112981112982112983112984112985112986112987112988112989112990112991112992112993112994112995112996112997112998112999113000113001113002113003113004113005113006113007113008113009113010113011113012113013113014113015113016113017113018113019113020113021113022113023113024113025113026113027113028113029113030113031113032113033113034113035113036113037113038113039113040113041113042113043113044113045113046113047113048113049113050113051113052113053113054113055113056113057113058113059113060113061113062113063113064113065113066113067113068113069113070113071113072113073113074113075113076113077113078113079113080113081113082113083113084113085113086113087113088113089113090113091113092113093113094113095113096113097113098113099113100113101113102113103113104113105113106113107113108113109113110113111113112113113113114113115113116113117113118113119113120113121113122113123113124113125113126113127113128113129113130113131113132113133113134113135113136113137113138113139113140113141113142113143113144113145113146113147113148113149113150113151113152113153113154113155113156113157113158113159113160113161113162113163113164113165113166113167113168113169113170113171113172113173113174113175113176113177113178113179113180113181113182113183113184113185113186113187113188113189113190113191113192113193113194113195113196113197113198113199113200113201113202113203113204113205113206113207113208113209113210113211113212113213113214113215113216113217113218113219113220113221113222113223113224113225113226113227113228113229113230113231113232113233113234113235113236113237113238113239113240113241113242113243113244113245113246113247113248113249113250113251113252113253113254113255113256113257113258113259113260113261113262113263113264113265113266113267113268113269113270113271113272113273113274113275113276113277113278113279113280113281113282113283113284113285113286113287113288113289113290113291113292113293113294113295113296113297113298113299113300113301113302113303113304113305113306113307113308113309113310113311113312113313113314113315113316113317113318113319113320113321113322113323113324113325113326113327113328113329113330113331113332113333113334113335113336113337113338113339113340113341113342113343113344113345113346113347113348113349113350113351113352113353113354113355113356113357113358113359113360113361113362113363113364113365113366113367113368113369113370113371113372113373113374113375113376113377113378113379113380113381113382113383113384113385113386113387113388113389113390113391113392113393113394113395113396113397113398113399113400113401113402113403113404113405113406113407113408113409113410113411113412113413113414113415113416113417113418113419113420113421113422113423113424113425113426113427113428113429113430113431113432113433113434113435113436113437113438113439113440113441113442113443113444113445113446113447113448113449113450113451113452113453113454113455113456113457113458113459113460113461113462113463113464113465113466113467113468113469113470113471113472113473113474113475113476113477113478113479113480113481113482113483113484113485113486113487113488113489113490113491113492113493113494113495113496113497113498113499113500113501113502113503113504113505113506113507113508113509113510113511113512113513113514113515113516113517113518113519113520113521113522113523113524113525113526113527113528113529113530113531113532113533113534113535113536113537113538113539113540113541113542113543113544113545113546113547113548113549113550113551113552113553113554113555113556113557113558113559113560113561113562113563113564113565113566113567113568113569113570113571113572113573113574113575113576113577113578113579113580113581113582113583113584113585113586113587113588113589113590113591113592113593113594113595113596113597113598113599113600113601113602113603113604113605113606113607113608113609113610113611113612113613113614113615113616113617113618113619113620113621113622113623113624113625113626113627113628113629113630113631113632113633113634113635113636113637113638113639113640113641113642113643113644113645113646113647113648113649113650113651113652113653113654113655113656113657113658113659113660113661113662113663113664113665113666113667113668113669113670113671113672113673113674113675113676113677113678113679113680113681113682113683113684113685113686113687113688113689113690113691113692113693113694113695113696113697113698113699113700113701113702113703113704113705113706113707113708113709113710113711113712113713113714113715113716113717113718113719113720113721113722113723113724113725113726113727113728113729113730113731113732113733113734113735113736113737113738113739113740113741113742113743113744113745113746113747113748113749113750113751113752113753113754113755113756113757113758113759113760113761113762113763113764113765113766113767113768113769113770113771113772113773113774113775113776113777113778113779113780113781113782113783113784113785113786113787113788113789113790113791113792113793113794113795113796113797113798113799113800113801113802113803113804113805113806113807113808113809113810113811113812113813113814113815113816113817113818113819113820113821113822113823113824113825113826113827113828113829113830113831113832113833113834113835113836113837113838113839113840113841113842113843113844113845113846113847113848113849113850113851113852113853113854113855113856113857113858113859113860113861113862113863113864113865113866113867113868113869113870113871113872113873113874113875113876113877113878113879113880113881113882113883113884113885113886113887113888113889113890113891113892113893113894113895113896113897113898113899113900113901113902113903113904113905113906113907113908113909113910113911113912113913113914113915113916113917113918113919113920113921113922113923113924113925113926113927113928113929113930113931113932113933113934113935113936113937113938113939113940113941113942113943113944113945113946113947113948113949113950113951113952113953113954113955113956113957113958113959113960113961113962113963113964113965113966113967113968113969113970113971113972113973113974113975113976113977113978113979113980113981113982113983113984113985113986113987113988113989113990113991113992113993113994113995113996113997113998113999114000114001114002114003114004114005114006114007114008114009114010114011114012114013114014114015114016114017114018114019114020114021114022114023114024114025114026114027114028114029114030114031114032114033114034114035114036114037114038114039114040114041114042114043114044114045114046114047114048114049114050114051114052114053114054114055114056114057114058114059114060114061114062114063114064114065114066114067114068114069114070114071114072114073114074114075114076114077114078114079114080114081114082114083114084114085114086114087114088114089114090114091114092114093114094114095114096114097114098114099114100114101114102114103114104114105114106114107114108114109114110114111114112114113114114114115114116114117114118114119114120114121114122114123114124114125114126114127114128114129114130114131114132114133114134114135114136114137114138114139114140114141114142114143114144114145114146114147114148114149114150114151114152114153114154114155114156114157114158114159114160114161114162114163114164114165114166114167114168114169114170114171114172114173114174114175114176114177114178114179114180114181114182114183114184114185114186114187114188114189114190114191114192114193114194114195114196114197114198114199114200114201114202114203114204114205114206114207114208114209114210114211114212114213114214114215114216114217114218114219114220114221114222114223114224114225114226114227114228114229114230114231114232114233114234114235114236114237114238114239114240114241114242114243114244114245114246114247114248114249114250114251114252114253114254114255114256114257114258114259114260114261114262114263114264114265114266114267114268114269114270114271114272114273114274114275114276114277114278114279114280114281114282114283114284114285114286114287114288114289114290114291114292114293114294114295114296114297114298114299114300114301114302114303114304114305114306114307114308114309114310114311114312114313114314114315114316114317114318114319114320114321114322114323114324114325114326114327114328114329114330114331114332114333114334114335114336114337114338114339114340114341114342114343114344114345114346114347114348114349114350114351114352114353114354114355114356114357114358114359114360114361114362114363114364114365114366114367114368114369114370114371114372114373114374114375114376114377114378114379114380114381114382114383114384114385114386114387114388114389114390114391114392114393114394114395114396114397114398114399114400114401114402114403114404114405114406114407114408114409114410114411114412114413114414114415114416114417114418114419114420114421114422114423114424114425114426114427114428114429114430114431114432114433114434114435114436114437114438114439114440114441114442114443114444114445114446114447114448114449114450114451114452114453114454114455114456114457114458114459114460114461114462114463114464114465114466114467114468114469114470114471114472114473114474114475114476114477114478114479114480114481114482114483114484114485114486114487114488114489114490114491114492114493114494114495114496114497114498114499114500114501114502114503114504114505114506114507114508114509114510114511114512114513114514114515114516114517114518114519114520114521114522114523114524114525114526114527114528114529114530114531114532114533114534114535114536114537114538114539114540114541114542114543114544114545114546114547114548114549114550114551114552114553114554114555114556114557114558114559114560114561114562114563114564114565114566114567114568114569114570114571114572114573114574114575114576114577114578114579114580114581114582114583114584114585114586114587114588114589114590114591114592114593114594114595114596114597114598114599114600114601114602114603114604114605114606114607114608114609114610114611114612114613114614114615114616114617114618114619114620114621114622114623114624114625114626114627114628114629114630114631114632114633114634114635114636114637114638114639114640114641114642114643114644114645114646114647114648114649114650114651114652114653114654114655114656114657114658114659114660114661114662114663114664114665114666114667114668114669114670114671114672114673114674114675114676114677114678114679114680114681114682114683114684114685114686114687114688114689114690114691114692114693114694114695114696114697114698114699114700114701114702114703114704114705114706114707114708114709114710114711114712114713114714114715114716114717114718114719114720114721114722114723114724114725114726114727114728114729114730114731114732114733114734114735114736114737114738114739114740114741114742114743114744114745114746114747114748114749114750114751114752114753114754114755114756114757114758114759114760114761114762114763114764114765114766114767114768114769114770114771114772114773114774114775114776114777114778114779114780114781114782114783114784114785114786114787114788114789114790114791114792114793114794114795114796114797114798114799114800114801114802114803114804114805114806114807114808114809114810114811114812114813114814114815114816114817114818114819114820114821114822114823114824114825114826114827114828114829114830114831114832114833114834114835114836114837114838114839114840114841114842114843114844114845114846114847114848114849114850114851114852114853114854114855114856114857114858114859114860114861114862114863114864114865114866114867114868114869114870114871114872114873114874114875114876114877114878114879114880114881114882114883114884114885114886114887114888114889114890114891114892114893114894114895114896114897114898114899114900114901114902114903114904114905114906114907114908114909114910114911114912114913114914114915114916114917114918114919114920114921114922114923114924114925114926114927114928114929114930114931114932114933114934114935114936114937114938114939114940114941114942114943114944114945114946114947114948114949114950114951114952114953114954114955114956114957114958114959114960114961114962114963114964114965114966114967114968114969114970114971114972114973114974114975114976114977114978114979114980114981114982114983114984114985114986114987114988114989114990114991114992114993114994114995114996114997114998114999115000115001115002115003115004115005115006115007115008115009115010115011115012115013115014115015115016115017115018115019115020115021115022115023115024115025115026115027115028115029115030115031115032115033115034115035115036115037115038115039115040115041115042115043115044115045115046115047115048115049115050115051115052115053115054115055115056115057115058115059115060115061115062115063115064115065115066115067115068115069115070115071115072115073115074115075115076115077115078115079115080115081115082115083115084115085115086115087115088115089115090115091115092115093115094115095115096115097115098115099115100115101115102115103115104115105115106115107115108115109115110115111115112115113115114115115115116115117115118115119115120115121115122115123115124115125115126115127115128115129115130115131115132115133115134115135115136115137115138115139115140115141115142115143115144115145115146115147115148115149115150115151115152115153115154115155115156115157115158115159115160115161115162115163115164115165115166115167115168115169115170115171115172115173115174115175115176115177115178115179115180115181115182115183115184115185115186115187115188115189115190115191115192115193115194115195115196115197115198115199115200115201115202115203115204115205115206115207115208115209115210115211115212115213115214115215115216115217115218115219115220115221115222115223115224115225115226115227115228115229115230115231115232115233115234115235115236115237115238115239115240115241115242115243115244115245115246115247115248115249115250115251115252115253115254115255115256115257115258115259115260115261115262115263115264115265115266115267115268115269115270115271115272115273115274115275115276115277115278115279115280115281115282115283115284115285115286115287115288115289115290115291115292115293115294115295115296115297115298115299115300115301115302115303115304115305115306115307115308115309115310115311115312115313115314115315115316115317115318115319115320115321115322115323115324115325115326115327115328115329115330115331115332115333115334115335115336115337115338115339115340115341115342115343115344115345115346115347115348115349115350115351115352115353115354115355115356115357115358115359115360115361115362115363115364115365115366115367115368115369115370115371115372115373115374115375115376115377115378115379115380115381115382115383115384115385115386115387115388115389115390115391115392115393115394115395115396115397115398115399115400115401115402115403115404115405115406115407115408115409115410115411115412115413115414115415115416115417115418115419115420115421115422115423115424115425115426115427115428115429115430115431115432115433115434115435115436115437115438115439115440115441115442115443115444115445115446115447115448115449115450115451115452115453115454115455115456115457115458115459115460115461115462115463115464115465115466115467115468115469115470115471115472115473115474115475115476115477115478115479115480115481115482115483115484115485115486115487115488115489115490115491115492115493115494115495115496115497115498115499115500115501115502115503115504115505115506115507115508115509115510115511115512115513115514115515115516115517115518115519115520115521115522115523115524115525115526115527115528115529115530115531115532115533115534115535115536115537115538115539115540115541115542115543115544115545115546115547115548115549115550115551115552115553115554115555115556115557115558115559115560115561115562115563115564115565115566115567115568115569115570115571115572115573115574115575115576115577115578115579115580115581115582115583115584115585115586115587115588115589115590115591115592115593115594115595115596115597115598115599115600115601115602115603115604115605115606115607115608115609115610115611115612115613115614115615115616115617115618115619115620115621115622115623115624115625115626115627115628115629115630115631115632115633115634115635115636115637115638115639115640115641115642115643115644115645115646115647115648115649115650115651115652115653115654115655115656115657115658115659115660115661115662115663115664115665115666115667115668115669115670115671115672115673115674115675115676115677115678115679115680115681115682115683115684115685115686115687115688115689115690115691115692115693115694115695115696115697115698115699115700115701115702115703115704115705115706115707115708115709115710115711115712115713115714115715115716115717115718115719115720115721115722115723115724115725115726115727115728115729115730115731115732115733115734115735115736115737115738115739115740115741115742115743115744115745115746115747115748115749115750115751115752115753115754115755115756115757115758115759115760115761115762115763115764115765115766115767115768115769115770115771115772115773115774115775115776115777115778115779115780115781115782115783115784115785115786115787115788115789115790115791115792115793115794115795115796115797115798115799115800115801115802115803115804115805115806115807115808115809115810115811115812115813115814115815115816115817115818115819115820115821115822115823115824115825115826115827115828115829115830115831115832115833115834115835115836115837115838115839115840115841115842115843115844115845115846115847115848115849115850115851115852115853115854115855115856115857115858115859115860115861115862115863115864115865115866115867115868115869115870115871115872115873115874115875115876115877115878115879115880115881115882115883115884115885115886115887115888115889115890115891115892115893115894115895115896115897115898115899115900115901115902115903115904115905115906115907115908115909115910115911115912115913115914115915115916115917115918115919115920115921115922115923115924115925115926115927115928115929115930115931115932115933115934115935115936115937115938115939115940115941115942115943115944115945115946115947115948115949115950115951115952115953115954115955115956115957115958115959115960115961115962115963115964115965115966115967115968115969115970115971115972115973115974115975115976115977115978115979115980115981115982115983115984115985115986115987115988115989115990115991115992115993115994115995115996115997115998115999116000116001116002116003116004116005116006116007116008116009116010116011116012116013116014116015116016116017116018116019116020116021116022116023116024116025116026116027116028116029116030116031116032116033116034116035116036116037116038116039116040116041116042116043116044116045116046116047116048116049116050116051116052116053116054116055116056116057116058116059116060116061116062116063116064116065116066116067116068116069116070116071116072116073116074116075116076116077116078116079116080116081116082116083116084116085116086116087116088116089116090116091116092116093116094116095116096116097116098116099116100116101116102116103116104116105116106116107116108116109116110116111116112116113116114116115116116116117116118116119116120116121116122116123116124116125116126116127116128116129116130116131116132116133116134116135116136116137116138116139116140116141116142116143116144116145116146116147116148116149116150116151116152116153116154116155116156116157116158116159116160116161116162116163116164116165116166116167116168116169116170116171116172116173116174116175116176116177116178116179116180116181116182116183116184116185116186116187116188116189116190116191116192116193116194116195116196116197116198116199116200116201116202116203116204116205116206116207116208116209116210116211116212116213116214116215116216116217116218116219116220116221116222116223116224116225116226116227116228116229116230116231116232116233116234116235116236116237116238116239116240116241116242116243116244116245116246116247116248116249116250116251116252116253116254116255116256116257116258116259116260116261116262116263116264116265116266116267116268116269116270116271116272116273116274116275116276116277116278116279116280116281116282116283116284116285116286116287116288116289116290116291116292116293116294116295116296116297116298116299116300116301116302116303116304116305116306116307116308116309116310116311116312116313116314116315116316116317116318116319116320116321116322116323116324116325116326116327116328116329116330116331116332116333116334116335116336116337116338116339116340116341116342116343116344116345116346116347116348116349116350116351116352116353116354116355116356116357116358116359116360116361116362116363116364116365116366116367116368116369116370116371116372116373116374116375116376116377116378116379116380116381116382116383116384116385116386116387116388116389116390116391116392116393116394116395116396116397116398116399116400116401116402116403116404116405116406116407116408116409116410116411116412116413116414116415116416116417116418116419116420116421116422116423116424116425116426116427116428116429116430116431116432116433116434116435116436116437116438116439116440116441116442116443116444116445116446116447116448116449116450116451116452116453116454116455116456116457116458116459116460116461116462116463116464116465116466116467116468116469116470116471116472116473116474116475116476116477116478116479116480116481116482116483116484116485116486116487116488116489116490116491116492116493116494116495116496116497116498116499116500116501116502116503116504116505116506116507116508116509116510116511116512116513116514116515116516116517116518116519116520116521116522116523116524116525116526116527116528116529116530116531116532116533116534116535116536116537116538116539116540116541116542116543116544116545116546116547116548116549116550116551116552116553116554116555116556116557116558116559116560116561116562116563116564116565116566116567116568116569116570116571116572116573116574116575116576116577116578116579116580116581116582116583116584116585116586116587116588116589116590116591116592116593116594116595116596116597116598116599116600116601116602116603116604116605116606116607116608116609116610116611116612116613116614116615116616116617116618116619116620116621116622116623116624116625116626116627116628116629116630116631116632116633116634116635116636116637116638116639116640116641116642116643116644116645116646116647116648116649116650116651116652116653116654116655116656116657116658116659116660116661116662116663116664116665116666116667116668116669116670116671116672116673116674116675116676116677116678116679116680116681116682116683116684116685116686116687116688116689116690116691116692116693116694116695116696116697116698116699116700116701116702116703116704116705116706116707116708116709116710116711116712116713116714116715116716116717116718116719116720116721116722116723116724116725116726116727116728116729116730116731116732116733116734116735116736116737116738116739116740116741116742116743116744116745116746116747116748116749116750116751116752116753116754116755116756116757116758116759116760116761116762116763116764116765116766116767116768116769116770116771116772116773116774116775116776116777116778116779116780116781116782116783116784116785116786116787116788116789116790116791116792116793116794116795116796116797116798116799116800116801116802116803116804116805116806116807116808116809116810116811116812116813116814116815116816116817116818116819116820116821116822116823116824116825116826116827116828116829116830116831116832116833116834116835116836116837116838116839116840116841116842116843116844116845116846116847116848116849116850116851116852116853116854116855116856116857116858116859116860116861116862116863116864116865116866116867116868116869116870116871116872116873116874116875116876116877116878116879116880116881116882116883116884116885116886116887116888116889116890116891116892116893116894116895116896116897116898116899116900116901116902116903116904116905116906116907116908116909116910116911116912116913116914116915116916116917116918116919116920116921116922116923116924116925116926116927116928116929116930116931116932116933116934116935116936116937116938116939116940116941116942116943116944116945116946116947116948116949116950116951116952116953116954116955116956116957116958116959116960116961116962116963116964116965116966116967116968116969116970116971116972116973116974116975116976116977116978116979116980116981116982116983116984116985116986116987116988116989116990116991116992116993116994116995116996116997116998116999117000117001117002117003117004117005117006117007117008117009117010117011117012117013117014117015117016117017117018117019117020117021117022117023117024117025117026117027117028117029117030117031117032117033117034117035117036117037117038117039117040117041117042117043117044117045117046117047117048117049117050117051117052117053117054117055117056117057117058117059117060117061117062117063117064117065117066117067117068117069117070117071117072117073117074117075117076117077117078117079117080117081117082117083117084117085117086117087117088117089117090117091117092117093117094117095117096117097117098117099117100117101117102117103117104117105117106117107117108117109117110117111117112117113117114117115117116117117117118117119117120117121117122117123117124117125117126117127117128117129117130117131117132117133117134117135117136117137117138117139117140117141117142117143117144117145117146117147117148117149117150117151117152117153117154117155117156117157117158117159117160117161117162117163117164117165117166117167117168117169117170117171117172117173117174117175117176117177117178117179117180117181117182117183117184117185117186117187117188117189117190117191117192117193117194117195117196117197117198117199117200117201117202117203117204117205117206117207117208117209117210117211117212117213117214117215117216117217117218117219117220117221117222117223117224117225117226117227117228117229117230117231117232117233117234117235117236117237117238117239117240117241117242117243117244117245117246117247117248117249117250117251117252117253117254117255117256117257117258117259117260117261117262117263117264117265117266117267117268117269117270117271117272117273117274117275117276117277117278117279117280117281117282117283117284117285117286117287117288117289117290117291117292117293117294117295117296117297117298117299117300117301117302117303117304117305117306117307117308117309117310117311117312117313117314117315117316117317117318117319117320117321117322117323117324117325117326117327117328117329117330117331117332117333117334117335117336117337117338117339117340117341117342117343117344117345117346117347117348117349117350117351117352117353117354117355117356117357117358117359117360117361117362117363117364117365117366117367117368117369117370117371117372117373117374117375117376117377117378117379117380117381117382117383117384117385117386117387117388117389117390117391117392117393117394117395117396117397117398117399117400117401117402117403117404117405117406117407117408117409117410117411117412117413117414117415117416117417117418117419117420117421117422117423117424117425117426117427117428117429117430117431117432117433117434117435117436117437117438117439117440117441117442117443117444117445117446117447117448117449117450117451117452117453117454117455117456117457117458117459117460117461117462117463117464117465117466117467117468117469117470117471117472117473117474117475117476117477117478117479117480117481117482117483117484117485117486117487117488117489117490117491117492117493117494117495117496117497117498117499117500117501117502117503117504117505117506117507117508117509117510117511117512117513117514117515117516117517117518117519117520117521117522117523117524117525117526117527117528117529117530117531117532117533117534117535117536117537117538117539117540117541117542117543117544117545117546117547117548117549117550117551117552117553117554117555117556117557117558117559117560117561117562117563117564117565117566117567117568117569117570117571117572117573117574117575117576117577117578117579117580117581117582117583117584117585117586117587117588117589117590117591117592117593117594117595117596117597117598117599117600117601117602117603117604117605117606117607117608117609117610117611117612117613117614117615117616117617117618117619117620117621117622117623117624117625117626117627117628117629117630117631117632117633117634117635117636117637117638117639117640117641117642117643117644117645117646117647117648117649117650117651117652117653117654117655117656117657117658117659117660117661117662117663117664117665117666117667117668117669117670117671117672117673117674117675117676117677117678117679117680117681117682117683117684117685117686117687117688117689117690117691117692117693117694117695117696117697117698117699117700117701117702117703117704117705117706117707117708117709117710117711117712117713117714117715117716117717117718117719117720117721117722117723117724117725117726117727117728117729117730117731117732117733117734117735117736117737117738117739117740117741117742117743117744117745117746117747117748117749117750117751117752117753117754117755117756117757117758117759117760117761117762117763117764117765117766117767117768117769117770117771117772117773117774117775117776117777117778117779117780117781117782117783117784117785117786117787117788117789117790117791117792117793117794117795117796117797117798117799117800117801117802117803117804117805117806117807117808117809117810117811117812117813117814117815117816117817117818117819117820117821117822117823117824117825117826117827117828117829117830117831117832117833117834117835117836117837117838117839117840117841117842117843117844117845117846117847117848117849117850117851117852117853117854117855117856117857117858117859117860117861117862117863117864117865117866117867117868117869117870117871117872117873117874117875117876117877117878117879117880117881117882117883117884117885117886117887117888117889117890117891117892117893117894117895117896117897117898117899117900117901117902117903117904117905117906117907117908117909117910117911117912117913117914117915117916117917117918117919117920117921117922117923117924117925117926117927117928117929117930117931117932117933117934117935117936117937117938117939117940117941117942117943117944117945117946117947117948117949117950117951117952117953117954117955117956117957117958117959117960117961117962117963117964117965117966117967117968117969117970117971117972117973117974117975117976117977117978117979117980117981117982117983117984117985117986117987117988117989117990117991117992117993117994117995117996117997117998117999118000118001118002118003118004118005118006118007118008118009118010118011118012118013118014118015118016118017118018118019118020118021118022118023118024118025118026118027118028118029118030118031118032118033118034118035118036118037118038118039118040118041118042118043118044118045118046118047118048118049118050118051118052118053118054118055118056118057118058118059118060118061118062118063118064118065118066118067118068118069118070118071118072118073118074118075118076118077118078118079118080118081118082118083118084118085118086118087118088118089118090118091118092118093118094118095118096118097118098118099118100118101118102118103118104118105118106118107118108118109118110118111118112118113118114118115118116118117118118118119118120118121118122118123118124118125118126118127118128118129118130118131118132118133118134118135118136118137118138118139118140118141118142118143118144118145118146118147118148118149118150118151118152118153118154118155118156118157118158118159118160118161118162118163118164118165118166118167118168118169118170118171118172118173118174118175118176118177118178118179118180118181118182118183118184118185118186118187118188118189118190118191118192118193118194118195118196118197118198118199118200118201118202118203118204118205118206118207118208118209118210118211118212118213118214118215118216118217118218118219118220118221118222118223118224118225118226118227118228118229118230118231118232118233118234118235118236118237118238118239118240118241118242118243118244118245118246118247118248118249118250118251118252118253118254118255118256118257118258118259118260118261118262118263118264118265118266118267118268118269118270118271118272118273118274118275118276118277118278118279118280118281118282118283118284118285118286118287118288118289118290118291118292118293118294118295118296118297118298118299118300118301118302118303118304118305118306118307118308118309118310118311118312118313118314118315118316118317118318118319118320118321118322118323118324118325118326118327118328118329118330118331118332118333118334118335118336118337118338118339118340118341118342118343118344118345118346118347118348118349118350118351118352118353118354118355118356118357118358118359118360118361118362118363118364118365118366118367118368118369118370118371118372118373118374118375118376118377118378118379118380118381118382118383118384118385118386118387118388118389118390118391118392118393118394118395118396118397118398118399118400118401118402118403118404118405118406118407118408118409118410118411118412118413118414118415118416118417118418118419118420118421118422118423118424118425118426118427118428118429118430118431118432118433118434118435118436118437118438118439118440118441118442118443118444118445118446118447118448118449118450118451118452118453118454118455118456118457118458118459118460118461118462118463118464118465118466118467118468118469118470118471118472118473118474118475118476118477118478118479118480118481118482118483118484118485118486118487118488118489118490118491118492118493118494118495118496118497118498118499118500118501118502118503118504118505118506118507118508118509118510118511118512118513118514118515118516118517118518118519118520118521118522118523118524118525118526118527118528118529118530118531118532118533118534118535118536118537118538118539118540118541118542118543118544118545118546118547118548118549118550118551118552118553118554118555118556118557118558118559118560118561118562118563118564118565118566118567118568118569118570118571118572118573118574118575118576118577118578118579118580118581118582118583118584118585118586118587118588118589118590118591118592118593118594118595118596118597118598118599118600118601118602118603118604118605118606118607118608118609118610118611118612118613118614118615118616118617118618118619118620118621118622118623118624118625118626118627118628118629118630118631118632118633118634118635118636118637118638118639118640118641118642118643118644118645118646118647118648118649118650118651118652118653118654118655118656118657118658118659118660118661118662118663118664118665118666118667118668118669118670118671118672118673118674118675118676118677118678118679118680118681118682118683118684118685118686118687118688118689118690118691118692118693118694118695118696118697118698118699118700118701118702118703118704118705118706118707118708118709118710118711118712118713118714118715118716118717118718118719118720118721118722118723118724118725118726118727118728118729118730118731118732118733118734118735118736118737118738118739118740118741118742118743118744118745118746118747118748118749118750118751118752118753118754118755118756118757118758118759118760118761118762118763118764118765118766118767118768118769118770118771118772118773118774118775118776118777118778118779118780118781118782118783118784118785118786118787118788118789118790118791118792118793118794118795118796118797118798118799118800118801118802118803118804118805118806118807118808118809118810118811118812118813118814118815118816118817118818118819118820118821118822118823118824118825118826118827118828118829118830118831118832118833118834118835118836118837118838118839118840118841118842118843118844118845118846118847118848118849118850118851118852118853118854118855118856118857118858118859118860118861118862118863118864118865118866118867118868118869118870118871118872118873118874118875118876118877118878118879118880118881118882118883118884118885118886118887118888118889118890118891118892118893118894118895118896118897118898118899118900118901118902118903118904118905118906118907118908118909118910118911118912118913118914118915118916118917118918118919118920118921118922118923118924118925118926118927118928118929118930118931118932118933118934118935118936118937118938118939118940118941118942118943118944118945118946118947118948118949118950118951118952118953118954118955118956118957118958118959118960118961118962118963118964118965118966118967118968118969118970118971118972118973118974118975118976118977118978118979118980118981118982118983118984118985118986118987118988118989118990118991118992118993118994118995118996118997118998118999119000119001119002119003119004119005119006119007119008119009119010119011119012119013119014119015119016119017119018119019119020119021119022119023119024119025119026119027119028119029119030119031119032119033119034119035119036119037119038119039119040119041119042119043119044119045119046119047119048119049119050119051119052119053119054119055119056119057119058119059119060119061119062119063119064119065119066119067119068119069119070119071119072119073119074119075119076119077119078119079119080119081119082119083119084119085119086119087119088119089119090119091119092119093119094119095119096119097119098119099119100119101119102119103119104119105119106119107119108119109119110119111119112119113119114119115119116119117119118119119119120119121119122119123119124119125119126119127119128119129119130119131119132119133119134119135119136119137119138119139119140119141119142119143119144119145119146119147119148119149119150119151119152119153119154119155119156119157119158119159119160119161119162119163119164119165119166119167119168119169119170119171119172119173119174119175119176119177119178119179119180119181119182119183119184119185119186119187119188119189119190119191119192119193119194119195119196119197119198119199119200119201119202119203119204119205119206119207119208119209119210119211119212119213119214119215119216119217119218119219119220119221119222119223119224119225119226119227119228119229119230119231119232119233119234119235119236119237119238119239119240119241119242119243119244119245119246119247119248119249119250119251119252119253119254119255119256119257119258119259119260119261119262119263119264119265119266119267119268119269119270119271119272119273119274119275119276119277119278119279119280119281119282119283119284119285119286119287119288119289119290119291119292119293119294119295119296119297119298119299119300119301119302119303119304119305119306119307119308119309119310119311119312119313119314119315119316119317119318119319119320119321119322119323119324119325119326119327119328119329119330119331119332119333119334119335119336119337119338119339119340119341119342119343119344119345119346119347119348119349119350119351119352119353119354119355119356119357119358119359119360119361119362119363119364119365119366119367119368119369119370119371119372119373119374119375119376119377119378119379119380119381119382119383119384119385119386119387119388119389119390119391119392119393119394119395119396119397119398119399119400119401119402119403119404119405119406119407119408119409119410119411119412119413119414119415119416119417119418119419119420119421119422119423119424119425119426119427119428119429119430119431119432119433119434119435119436119437119438119439119440119441119442119443119444119445119446119447119448119449119450119451119452119453119454119455119456119457119458119459119460119461119462119463119464119465119466119467119468119469119470119471119472119473119474119475119476119477119478119479119480119481119482119483119484119485119486119487119488119489119490119491119492119493119494119495119496119497119498119499119500119501119502119503119504119505119506119507119508119509119510119511119512119513119514119515119516119517119518119519119520119521119522119523119524119525119526119527119528119529119530119531119532119533119534119535119536119537119538119539119540119541119542119543119544119545119546119547119548119549119550119551119552119553119554119555119556119557119558119559119560119561119562119563119564119565119566119567119568119569119570119571119572119573119574119575119576119577119578119579119580119581119582119583119584119585119586119587119588119589119590119591119592119593119594119595119596119597119598119599119600119601119602119603119604119605119606119607119608119609119610119611119612119613119614119615119616119617119618119619119620119621119622119623119624119625119626119627119628119629119630119631119632119633119634119635119636119637119638119639119640119641119642119643119644119645119646119647119648119649119650119651119652119653119654119655119656119657119658119659119660119661119662119663119664119665119666119667119668119669119670119671119672119673119674119675119676119677119678119679119680119681119682119683119684119685119686119687119688119689119690119691119692119693119694119695119696119697119698119699119700119701119702119703119704119705119706119707119708119709119710119711119712119713119714119715119716119717119718119719119720119721119722119723119724119725119726119727119728119729119730119731119732119733119734119735119736119737119738119739119740119741119742119743119744119745119746119747119748119749119750119751119752119753119754119755119756119757119758119759119760119761119762119763119764119765119766119767119768119769119770119771119772119773119774119775119776119777119778119779119780119781119782119783119784119785119786119787119788119789119790119791119792119793119794119795119796119797119798119799119800119801119802119803119804119805119806119807119808119809119810119811119812119813119814119815119816119817119818119819119820119821119822119823119824119825119826119827119828119829119830119831119832119833119834119835119836119837119838119839119840119841119842119843119844119845119846119847119848119849119850119851119852119853119854119855119856119857119858119859119860119861119862119863119864119865119866119867119868119869119870119871119872119873119874119875119876119877119878119879119880119881119882119883119884119885119886119887119888119889119890119891119892119893119894119895119896119897119898119899119900119901119902119903119904119905119906119907119908119909119910119911119912119913119914119915119916119917119918119919119920119921119922119923119924119925119926119927119928119929119930119931119932119933119934119935119936119937119938119939119940119941119942119943119944119945119946119947119948119949119950119951119952119953119954119955119956119957119958119959119960119961119962119963119964119965119966119967119968119969119970119971119972119973119974119975119976119977119978119979119980119981119982119983119984119985119986119987119988119989119990119991119992119993119994119995119996119997119998119999120000120001120002120003120004120005120006120007120008120009120010120011120012120013120014120015120016120017120018120019120020120021120022120023120024120025120026120027120028120029120030120031120032120033120034120035120036120037120038120039120040120041120042120043120044120045120046120047120048120049120050120051120052120053120054120055120056120057120058120059120060120061120062120063120064120065120066120067120068120069120070120071120072120073120074120075120076120077120078120079120080120081120082120083120084120085120086120087120088120089120090120091120092120093120094120095120096120097120098120099120100120101120102120103120104120105120106120107120108120109120110120111120112120113120114120115120116120117120118120119120120120121120122120123120124120125120126120127120128120129120130120131120132120133120134120135120136120137120138120139120140120141120142120143120144120145120146120147120148120149120150120151120152120153120154120155120156120157120158120159120160120161120162120163120164120165120166120167120168120169120170120171120172120173120174120175120176120177120178120179120180120181120182120183120184120185120186120187120188120189120190120191120192120193120194120195120196120197120198120199120200120201120202120203120204120205120206120207120208120209120210120211120212120213120214120215120216120217120218120219120220120221120222120223120224120225120226120227120228120229120230120231120232120233120234120235120236120237120238120239120240120241120242120243120244120245120246120247120248120249120250120251120252120253120254120255120256120257120258120259120260120261120262120263120264120265120266120267120268120269120270120271120272120273120274120275120276120277120278120279120280120281120282120283120284120285120286120287120288120289120290120291120292120293120294120295120296120297120298120299120300120301120302120303120304120305120306120307120308120309120310120311120312120313120314120315120316120317120318120319120320120321120322120323120324120325120326120327120328120329120330120331120332120333120334120335120336120337120338120339120340120341120342120343120344120345120346120347120348120349120350120351120352120353120354120355120356120357120358120359120360120361120362120363120364120365120366120367120368120369120370120371120372120373120374120375120376120377120378120379120380120381120382120383120384120385120386120387120388120389120390120391120392120393120394120395120396120397120398120399120400120401120402120403120404120405120406120407120408120409120410120411120412120413120414120415120416120417120418120419120420120421120422120423120424120425120426120427120428120429120430120431120432120433120434120435120436120437120438120439120440120441120442120443120444120445120446120447120448120449120450120451120452120453120454120455120456120457120458120459120460120461120462120463120464120465120466120467120468120469120470120471120472120473120474120475120476120477120478120479120480120481120482120483120484120485120486120487120488120489120490120491120492120493120494120495120496120497120498120499120500120501120502120503120504120505120506120507120508120509120510120511120512120513120514120515120516120517120518120519120520120521120522120523120524120525120526120527120528120529120530120531120532120533120534120535120536120537120538120539120540120541120542120543120544120545120546120547120548120549120550120551120552120553120554120555120556120557120558120559120560120561120562120563120564120565120566120567120568120569120570120571120572120573120574120575120576120577120578120579120580120581120582120583120584120585120586120587120588120589120590120591120592120593120594120595120596120597120598120599120600120601120602120603120604120605120606120607120608120609120610120611120612120613120614120615120616120617120618120619120620120621120622120623120624120625120626120627120628120629120630120631120632120633120634120635120636120637120638120639120640120641120642120643120644120645120646120647120648120649120650120651120652120653120654120655120656120657120658120659120660120661120662120663120664120665120666120667120668120669120670120671120672120673120674120675120676120677120678120679120680120681120682120683120684120685120686120687120688120689120690120691120692120693120694120695120696120697120698120699120700120701120702120703120704120705120706120707120708120709120710120711120712120713120714120715120716120717120718120719120720120721120722120723120724120725120726120727120728120729120730120731120732120733120734120735120736120737120738120739120740120741120742120743120744120745120746120747120748120749120750120751120752120753120754120755120756120757120758120759120760120761120762120763120764120765120766120767120768120769120770120771120772120773120774120775120776120777120778120779120780120781120782120783120784120785120786120787120788120789120790120791120792120793120794120795120796120797120798120799120800120801120802120803120804120805120806120807120808120809120810120811120812120813120814120815120816120817120818120819120820120821120822120823120824120825120826120827120828120829120830120831120832120833120834120835120836120837120838120839120840120841120842120843120844120845120846120847120848120849120850120851120852120853120854120855120856120857120858120859120860120861120862120863120864120865120866120867120868120869120870120871120872120873120874120875120876120877120878120879120880120881120882120883120884120885120886120887120888120889120890120891120892120893120894120895120896120897120898120899120900120901120902120903120904120905120906120907120908120909120910120911120912120913120914120915120916120917120918120919120920120921120922120923120924120925120926120927120928120929120930120931120932120933120934120935120936120937120938120939120940120941120942120943120944120945120946120947120948120949120950120951120952120953120954120955120956120957120958120959120960120961120962120963120964120965120966120967120968120969120970120971120972120973120974120975120976120977120978120979120980120981120982120983120984120985120986120987120988120989120990120991120992120993120994120995120996120997120998120999121000121001121002121003121004121005121006121007121008121009121010121011121012121013121014121015121016121017121018121019121020121021121022121023121024121025121026121027121028121029121030121031121032121033121034121035121036121037121038121039121040121041121042121043121044121045121046121047121048121049121050121051121052121053121054121055121056121057121058121059121060121061121062121063121064121065121066121067121068121069121070121071121072121073121074121075121076121077121078121079121080121081121082121083121084121085121086121087121088121089121090121091121092121093121094121095121096121097121098121099121100121101121102121103121104121105121106121107121108121109121110121111121112121113121114121115121116121117121118121119121120121121121122121123121124121125121126121127121128121129121130121131121132121133121134121135121136121137121138121139121140121141121142121143121144121145121146121147121148121149121150121151121152121153121154121155121156121157121158121159121160121161121162121163121164121165121166121167121168121169121170121171121172121173121174121175121176121177121178121179121180121181121182121183121184121185121186121187121188121189121190121191121192121193121194121195121196121197121198121199121200121201121202121203121204121205121206121207121208121209121210121211121212121213121214121215121216121217121218121219121220121221121222121223121224121225121226121227121228121229121230121231121232121233121234121235121236121237121238121239121240121241121242121243121244121245121246121247121248121249121250121251121252121253121254121255121256121257121258121259121260121261121262121263121264121265121266121267121268121269121270121271121272121273121274121275121276121277121278121279121280121281121282121283121284121285121286121287121288121289121290121291121292121293121294121295121296121297121298121299121300121301121302121303121304121305121306121307121308121309121310121311121312121313121314121315121316121317121318121319121320121321121322121323121324121325121326121327121328121329121330121331121332121333121334121335121336121337121338121339121340121341121342121343121344121345121346121347121348121349121350121351121352121353121354121355121356121357121358121359121360121361121362121363121364121365121366121367121368121369121370121371121372121373121374121375121376121377121378121379121380121381121382121383121384121385121386121387121388121389121390121391121392121393121394121395121396121397121398121399121400121401121402121403121404121405121406121407121408121409121410121411121412121413121414121415121416121417121418121419121420121421121422121423121424121425121426121427121428121429121430121431121432121433121434121435121436121437121438121439121440121441121442121443121444121445121446121447121448121449121450121451121452121453121454121455121456121457121458121459121460121461121462121463121464121465121466121467121468121469121470121471121472121473121474121475121476121477121478121479121480121481121482121483121484121485121486121487121488121489121490121491121492121493121494121495121496121497121498121499121500121501121502121503121504121505121506121507121508121509121510121511121512121513121514121515121516121517121518121519121520121521121522121523121524121525121526121527121528121529121530121531121532121533121534121535121536121537121538121539121540121541121542121543121544121545121546121547121548121549121550121551121552121553121554121555121556121557121558121559121560121561121562121563121564121565121566121567121568121569121570121571121572121573121574121575121576121577121578121579121580121581121582121583121584121585121586121587121588121589121590121591121592121593121594121595121596121597121598121599121600121601121602121603121604121605121606121607121608121609121610121611121612121613121614121615121616121617121618121619121620121621121622121623121624121625121626121627121628121629121630121631121632121633121634121635121636121637121638121639121640121641121642121643121644121645121646121647121648121649121650121651121652121653121654121655121656121657121658121659121660121661121662121663121664121665121666121667121668121669121670121671121672121673121674121675121676121677121678121679121680121681121682121683121684121685121686121687121688121689121690121691121692121693121694121695121696121697121698121699121700121701121702121703121704121705121706121707121708121709121710121711121712121713121714121715121716121717121718121719121720121721121722121723121724121725121726121727121728121729121730121731121732121733121734121735121736121737121738121739121740121741121742121743121744121745121746121747121748121749121750121751121752121753121754121755121756121757121758121759121760121761121762121763121764121765121766121767121768121769121770121771121772121773121774121775121776121777121778121779121780121781121782121783121784121785121786121787121788121789121790121791121792121793121794121795121796121797121798121799121800121801121802121803121804121805121806121807121808121809121810121811121812121813121814121815121816121817121818121819121820121821121822121823121824121825121826121827121828121829121830121831121832121833121834121835121836121837121838121839121840121841121842121843121844121845121846121847121848121849121850121851121852121853121854121855121856121857121858121859121860121861121862121863121864121865121866121867121868121869121870121871121872121873121874121875121876121877121878121879121880121881121882121883121884121885121886121887121888121889121890121891121892121893121894121895121896121897121898121899121900121901121902121903121904121905121906121907121908121909121910121911121912121913121914121915121916121917121918121919121920121921121922121923121924121925121926121927121928121929121930121931121932121933121934121935121936121937121938121939121940121941121942121943121944121945121946121947121948121949121950121951121952121953121954121955121956121957121958121959121960121961121962121963121964121965121966121967121968121969121970121971121972121973121974121975121976121977121978121979121980121981121982121983121984121985121986121987121988121989121990121991121992121993121994121995121996121997121998121999122000122001122002122003122004122005122006122007122008122009122010122011122012122013122014122015122016122017122018122019122020122021122022122023122024122025122026122027122028122029122030122031122032122033122034122035122036122037122038122039122040122041122042122043122044122045122046122047122048122049122050122051122052122053122054122055122056122057122058122059122060122061122062122063122064122065122066122067122068122069122070122071122072122073122074122075122076122077122078122079122080122081122082122083122084122085122086122087122088122089122090122091122092122093122094122095122096122097122098122099122100122101122102122103122104122105122106122107122108122109122110122111122112122113122114122115122116122117122118122119122120122121122122122123122124122125122126122127122128122129122130122131122132122133122134122135122136122137122138122139122140122141122142122143122144122145122146122147122148122149122150122151122152122153122154122155122156122157122158122159122160122161122162122163122164122165122166122167122168122169122170122171122172122173122174122175122176122177122178122179122180122181122182122183122184122185122186122187122188122189122190122191122192122193122194122195122196122197122198122199122200122201122202122203122204122205122206122207122208122209122210122211122212122213122214122215122216122217122218122219122220122221122222122223122224122225122226122227122228122229122230122231122232122233122234122235122236122237122238122239122240122241122242122243122244122245122246122247122248122249122250122251122252122253122254122255122256122257122258122259122260122261122262122263122264122265122266122267122268122269122270122271122272122273122274122275122276122277122278122279122280122281122282122283122284122285122286122287122288122289122290122291122292122293122294122295122296122297122298122299122300122301122302122303122304122305122306122307122308122309122310122311122312122313122314122315122316122317122318122319122320122321122322122323122324122325122326122327122328122329122330122331122332122333122334122335122336122337122338122339122340122341122342122343122344122345122346122347122348122349122350122351122352122353122354122355122356122357122358122359122360122361122362122363122364122365122366122367122368122369122370122371122372122373122374122375122376122377122378122379122380122381122382122383122384122385122386122387122388122389122390122391122392122393122394122395122396122397122398122399122400122401122402122403122404122405122406122407122408122409122410122411122412122413122414122415122416122417122418122419122420122421122422122423122424122425122426122427122428122429122430122431122432122433122434122435122436122437122438122439122440122441122442122443122444122445122446122447122448122449122450122451122452122453122454122455122456122457122458122459122460122461122462122463122464122465122466122467122468122469122470122471122472122473122474122475122476122477122478122479122480122481122482122483122484122485122486122487122488122489122490122491122492122493122494122495122496122497122498122499122500122501122502122503122504122505122506122507122508122509122510122511122512122513122514122515122516122517122518122519122520122521122522122523122524122525122526122527122528122529122530122531122532122533122534122535122536122537122538122539122540122541122542122543122544122545122546122547122548122549122550122551122552122553122554122555122556122557122558122559122560122561122562122563122564122565122566122567122568122569122570122571122572122573122574122575122576122577122578122579122580122581122582122583122584122585122586122587122588122589122590122591122592122593122594122595122596122597122598122599122600122601122602122603122604122605122606122607122608122609122610122611122612122613122614122615122616122617122618122619122620122621122622122623122624122625122626122627122628122629122630122631122632122633122634122635122636122637122638122639122640122641122642122643122644122645122646122647122648122649122650122651122652122653122654122655122656122657122658122659122660122661122662122663122664122665122666122667122668122669122670122671122672122673122674122675122676122677122678122679122680122681122682122683122684122685122686122687122688122689122690122691122692122693122694122695122696122697122698122699122700122701122702122703122704122705122706122707122708122709122710122711122712122713122714122715122716122717122718122719122720122721122722122723122724122725122726122727122728122729122730122731122732122733122734122735122736122737122738122739122740122741122742122743122744122745122746122747122748122749122750122751122752122753122754122755122756122757122758122759122760122761122762122763122764122765122766122767122768122769122770122771122772122773122774122775122776122777122778122779122780122781122782122783122784122785122786122787122788122789122790122791122792122793122794122795122796122797122798122799122800122801122802122803122804122805122806122807122808122809122810122811122812122813122814122815122816122817122818122819122820122821122822122823122824122825122826122827122828122829122830122831122832122833122834122835122836122837122838122839122840122841122842122843122844122845122846122847122848122849122850122851122852122853122854122855122856122857122858122859122860122861122862122863122864122865122866122867122868122869122870122871122872122873122874122875122876122877122878122879122880122881122882122883122884122885122886122887122888122889122890122891122892122893122894122895122896122897122898122899122900122901122902122903122904122905122906122907122908122909122910122911122912122913122914122915122916122917122918122919122920122921122922122923122924122925122926122927122928122929122930122931122932122933122934122935122936122937122938122939122940122941122942122943122944122945122946122947122948122949122950122951122952122953122954122955122956122957122958122959122960122961122962122963122964122965122966122967122968122969122970122971122972122973122974122975122976122977122978122979122980122981122982122983122984122985122986122987122988122989122990122991122992122993122994122995122996122997122998122999123000123001123002123003123004123005123006123007123008123009123010123011123012123013123014123015123016123017123018123019123020123021123022123023123024123025123026123027123028123029123030123031123032123033123034123035123036123037123038123039123040123041123042123043123044123045123046123047123048123049123050123051123052123053123054123055123056123057123058123059123060123061123062123063123064123065123066123067123068123069123070123071123072123073123074123075123076123077123078123079123080123081123082123083123084123085123086123087123088123089123090123091123092123093123094123095123096123097123098123099123100123101123102123103123104123105123106123107123108123109123110123111123112123113123114123115123116123117123118123119123120123121123122123123123124123125123126123127123128123129123130123131123132123133123134123135123136123137123138123139123140123141123142123143123144123145123146123147123148123149123150123151123152123153123154123155123156123157123158123159123160123161123162123163123164123165123166123167123168123169123170123171123172123173123174123175123176123177123178123179123180123181123182123183123184123185123186123187123188123189123190123191123192123193123194123195123196123197123198123199123200123201123202123203123204123205123206123207123208123209123210123211123212123213123214123215123216123217123218123219123220123221123222123223123224123225123226123227123228123229123230123231123232123233123234123235123236123237123238123239123240123241123242123243123244123245123246123247123248123249123250123251123252123253123254123255123256123257123258123259123260123261123262123263123264123265123266123267123268123269123270123271123272123273123274123275123276123277123278123279123280123281123282123283123284123285123286123287123288123289123290123291123292123293123294123295123296123297123298123299123300123301123302123303123304123305123306123307123308123309123310123311123312123313123314123315123316123317123318123319123320123321123322123323123324123325123326123327123328123329123330123331123332123333123334123335123336123337123338123339123340123341123342123343123344123345123346123347123348123349123350123351123352123353123354123355123356123357123358123359123360123361123362123363123364123365123366123367123368123369123370123371123372123373123374123375123376123377123378123379123380123381123382123383123384123385123386123387123388123389123390123391123392123393123394123395123396123397123398123399123400123401123402123403123404123405123406123407123408123409123410123411123412123413123414123415123416123417123418123419123420123421123422123423123424123425123426123427123428123429123430123431123432123433123434123435123436123437123438123439123440123441123442123443123444123445123446123447123448123449123450123451123452123453123454123455123456123457123458123459123460123461123462123463123464123465123466123467123468123469123470123471123472123473123474123475123476123477123478123479123480123481123482123483123484123485123486123487123488123489123490123491123492123493123494123495123496123497123498123499123500123501123502123503123504123505123506123507123508123509123510123511123512123513123514123515123516123517123518123519123520123521123522123523123524123525123526123527123528123529123530123531123532123533123534123535123536123537123538123539123540123541123542123543123544123545123546123547123548123549123550123551123552123553123554123555123556123557123558123559123560123561123562123563123564123565123566123567123568123569123570123571123572123573123574123575123576123577123578123579123580123581123582123583123584123585123586123587123588123589123590123591123592123593123594123595123596123597123598123599123600123601123602123603123604123605123606123607123608123609123610123611123612123613123614123615123616123617123618123619123620123621123622123623123624123625123626123627123628123629123630123631123632123633123634123635123636123637123638123639123640123641123642123643123644123645123646123647123648123649123650123651123652123653123654123655123656123657123658123659123660123661123662123663123664123665123666123667123668123669123670123671123672123673123674123675123676123677123678123679123680123681123682123683123684123685123686123687123688123689123690123691123692123693123694123695123696123697123698123699123700123701123702123703123704123705123706123707123708123709123710123711123712123713123714123715123716123717123718123719123720123721123722123723123724123725123726123727123728123729123730123731123732123733123734123735123736123737123738123739123740123741123742123743123744123745123746123747123748123749123750123751123752123753123754123755123756123757123758123759123760123761123762123763123764123765123766123767123768123769123770123771123772123773123774123775123776123777123778123779123780123781123782123783123784123785123786123787123788123789123790123791123792123793123794123795123796123797123798123799123800123801123802123803123804123805123806123807123808123809123810123811123812123813123814123815123816123817123818123819123820123821123822123823123824123825123826123827123828123829123830123831123832123833123834123835123836123837123838123839123840123841123842123843123844123845123846123847123848123849123850123851123852123853123854123855123856123857123858123859123860123861123862123863123864123865123866123867123868123869123870123871123872123873123874123875123876123877123878123879123880123881123882123883123884123885123886123887123888123889123890123891123892123893123894123895123896123897123898123899123900123901123902123903123904123905123906123907123908123909123910123911123912123913123914123915123916123917123918123919123920123921123922123923123924123925123926123927123928123929123930123931123932123933123934123935123936123937123938123939123940123941123942123943123944123945123946123947123948123949123950123951123952123953123954123955123956123957123958123959123960123961123962123963123964123965123966123967123968123969123970123971123972123973123974123975123976123977123978123979123980123981123982123983123984123985123986123987123988123989123990123991123992123993123994123995123996123997123998123999124000124001124002124003124004124005124006124007124008124009124010124011124012124013124014124015124016124017124018124019124020124021124022124023124024124025124026124027124028124029124030124031124032124033124034124035124036124037124038124039124040124041124042124043124044124045124046124047124048124049124050124051124052124053124054124055124056124057124058124059124060124061124062124063124064124065124066124067124068124069124070124071124072124073124074124075124076124077124078124079124080124081124082124083124084124085124086124087124088124089124090124091124092124093124094124095124096124097124098124099124100124101124102124103124104124105124106124107124108124109124110124111124112124113124114124115124116124117124118124119124120124121124122124123124124124125124126124127124128124129124130124131124132124133124134124135124136124137124138124139124140124141124142124143124144124145124146124147124148124149124150124151124152124153124154124155124156124157124158124159124160124161124162124163124164124165124166124167124168124169124170124171124172124173124174124175124176124177124178124179124180124181124182124183124184124185124186124187124188124189124190124191124192124193124194124195124196124197124198124199124200124201124202124203124204124205124206124207124208124209124210124211124212124213124214124215124216124217124218124219124220124221124222124223124224124225124226124227124228124229124230124231124232124233124234124235124236124237124238124239124240124241124242124243124244124245124246124247124248124249124250124251124252124253124254124255124256124257124258124259124260124261124262124263124264124265124266124267124268124269124270124271124272124273124274124275124276124277124278124279124280124281124282124283124284124285124286124287124288124289124290124291124292124293124294124295124296124297124298124299124300124301124302124303124304124305124306124307124308124309124310124311124312124313124314124315124316124317124318124319124320124321124322124323124324124325124326124327124328124329124330124331124332124333124334124335124336124337124338124339124340124341124342124343124344124345124346124347124348124349124350124351124352124353124354124355124356124357124358124359124360124361124362124363124364124365124366124367124368124369124370124371124372124373124374124375124376124377124378124379124380124381124382124383124384124385124386124387124388124389124390124391124392124393124394124395124396124397124398124399124400124401124402124403124404124405124406124407124408124409124410124411124412124413124414124415124416124417124418124419124420124421124422124423124424124425124426124427124428124429124430124431124432124433124434124435124436124437124438124439124440124441124442124443124444124445124446124447124448124449124450124451124452124453124454124455124456124457124458124459124460124461124462124463124464124465124466124467124468124469124470124471124472124473124474124475124476124477124478124479124480124481124482124483124484124485124486124487124488124489124490124491124492124493124494124495124496124497124498124499124500124501124502124503124504124505124506124507124508124509124510124511124512124513124514124515124516124517124518124519124520124521124522124523124524124525124526124527124528124529124530124531124532124533124534124535124536124537124538124539124540124541124542124543124544124545124546124547124548124549124550124551124552124553124554124555124556124557124558124559124560124561124562124563124564124565124566124567124568124569124570124571124572124573124574124575124576124577124578124579124580124581124582124583124584124585124586124587124588124589124590124591124592124593124594124595124596124597124598124599124600124601124602124603124604124605124606124607124608124609124610124611124612124613124614124615124616124617124618124619124620124621124622124623124624124625124626124627124628124629124630124631124632124633124634124635124636124637124638124639124640124641124642124643124644124645124646124647124648124649124650124651124652124653124654124655124656124657124658124659124660124661124662124663124664124665124666124667124668124669124670124671124672124673124674124675124676124677124678124679124680124681124682124683124684124685124686124687124688124689124690124691124692124693124694124695124696124697124698124699124700124701124702124703124704124705124706124707124708124709124710124711124712124713124714124715124716124717124718124719124720124721124722124723124724124725124726124727124728124729124730124731124732124733124734124735124736124737124738124739124740124741124742124743124744124745124746124747124748124749124750124751124752124753124754124755124756124757124758124759124760124761124762124763124764124765124766124767124768124769124770124771124772124773124774124775124776124777124778124779124780124781124782124783124784124785124786124787124788124789124790124791124792124793124794124795124796124797124798124799124800124801124802124803124804124805124806124807124808124809124810124811124812124813124814124815124816124817124818124819124820124821124822124823124824124825124826124827124828124829124830124831124832124833124834124835124836124837124838124839124840124841124842124843124844124845124846124847124848124849124850124851124852124853124854124855124856124857124858124859124860124861124862124863124864124865124866124867124868124869124870124871124872124873124874124875124876124877124878124879124880124881124882124883124884124885124886124887124888124889124890124891124892124893124894124895124896124897124898124899124900124901124902124903124904124905124906124907124908124909124910124911124912124913124914124915124916124917124918124919124920124921124922124923124924124925124926124927124928124929124930124931124932124933124934124935124936124937124938124939124940124941124942124943124944124945124946124947124948124949124950124951124952124953124954124955124956124957124958124959124960124961124962124963124964124965124966124967124968124969124970124971124972124973124974124975124976124977124978124979124980124981124982124983124984124985124986124987124988124989124990124991124992124993124994124995124996124997124998124999125000125001125002125003125004125005125006125007125008125009125010125011125012125013125014125015125016125017125018125019125020125021125022125023125024125025125026125027125028125029125030125031125032125033125034125035125036125037125038125039125040125041125042125043125044125045125046125047125048125049125050125051125052125053125054125055125056125057125058125059125060125061125062125063125064125065125066125067125068125069125070125071125072125073125074125075125076125077125078125079125080125081125082125083125084125085125086125087125088125089125090125091125092125093125094125095125096125097125098125099125100125101125102125103125104125105125106125107125108125109125110125111125112125113125114125115125116125117125118125119125120125121125122125123125124125125125126125127125128125129125130125131125132125133125134125135125136125137125138125139125140125141125142125143125144125145125146125147125148125149125150125151125152125153125154125155125156125157125158125159125160125161125162125163125164125165125166125167125168125169125170125171125172125173125174125175125176125177125178125179125180125181125182125183125184125185125186125187125188125189125190125191125192125193125194125195125196125197125198125199125200125201125202125203125204125205125206125207125208125209125210125211125212125213125214125215125216125217125218125219125220125221125222125223125224125225125226125227125228125229125230125231125232125233125234125235125236125237125238125239125240125241125242125243125244125245125246125247125248125249125250125251125252125253125254125255125256125257125258125259125260125261125262125263125264125265125266125267125268125269125270125271125272125273125274125275125276125277125278125279125280125281125282125283125284125285125286125287125288125289125290125291125292125293125294125295125296125297125298125299125300125301125302125303125304125305125306125307125308125309125310125311125312125313125314125315125316125317125318125319125320125321125322125323125324125325125326125327125328125329125330125331125332125333125334125335125336125337125338125339125340125341125342125343125344125345125346125347125348125349125350125351125352125353125354125355125356125357125358125359125360125361125362125363125364125365125366125367125368125369125370125371125372125373125374125375125376125377125378125379125380125381125382125383125384125385125386125387125388125389125390125391125392125393125394125395125396125397125398125399125400125401125402125403125404125405125406125407125408125409125410125411125412125413125414125415125416125417125418125419125420125421125422125423125424125425125426125427125428125429125430125431125432125433125434125435125436125437125438125439125440125441125442125443125444125445125446125447125448125449125450125451125452125453125454125455125456125457125458125459125460125461125462125463125464125465125466125467125468125469125470125471125472125473125474125475125476125477125478125479125480125481125482125483125484125485125486125487125488125489125490125491125492125493125494125495125496125497125498125499125500125501125502125503125504125505125506125507125508125509125510125511125512125513125514125515125516125517125518125519125520125521125522125523125524125525125526125527125528125529125530125531125532125533125534125535125536125537125538125539125540125541125542125543125544125545125546125547125548125549125550125551125552125553125554125555125556125557125558125559125560125561125562125563125564125565125566125567125568125569125570125571125572125573125574125575125576125577125578125579125580125581125582125583125584125585125586125587125588125589125590125591125592125593125594125595125596125597125598125599125600125601125602125603125604125605125606125607125608125609125610125611125612125613125614125615125616125617125618125619125620125621125622125623125624125625125626125627125628125629125630125631125632125633125634125635125636125637125638125639125640125641125642125643125644125645125646125647125648125649125650125651125652125653125654125655125656125657125658125659125660125661125662125663125664125665125666125667125668125669125670125671125672125673125674125675125676125677125678125679125680125681125682125683125684125685125686125687125688125689125690125691125692125693125694125695125696125697125698125699125700125701125702125703125704125705125706125707125708125709125710125711125712125713125714125715125716125717125718125719125720125721125722125723125724125725125726125727125728125729125730125731125732125733125734125735125736125737125738125739125740125741125742125743125744125745125746125747125748125749125750125751125752125753125754125755125756125757125758125759125760125761125762125763125764125765125766125767125768125769125770125771125772125773125774125775125776125777125778125779125780125781125782125783125784125785125786125787125788125789125790125791125792125793125794125795125796125797125798125799125800125801125802125803125804125805125806125807125808125809125810125811125812125813125814125815125816125817125818125819125820125821125822125823125824125825125826125827125828125829125830125831125832125833125834125835125836125837125838125839125840125841125842125843125844125845125846125847125848125849125850125851125852125853125854125855125856125857125858125859125860125861125862125863125864125865125866125867125868125869125870125871125872125873125874125875125876125877125878125879125880125881125882125883125884125885125886125887125888125889125890125891125892125893125894125895125896125897125898125899125900125901125902125903125904125905125906125907125908125909125910125911125912125913125914125915125916125917125918125919125920125921125922125923125924125925125926125927125928125929125930125931125932125933125934125935125936125937125938125939125940125941125942125943125944125945125946125947125948125949125950125951125952125953125954125955125956125957125958125959125960125961125962125963125964125965125966125967125968125969125970125971125972125973125974125975125976125977125978125979125980125981125982125983125984125985125986125987125988125989125990125991125992125993125994125995125996125997125998125999126000126001126002126003126004126005126006126007126008126009126010126011126012126013126014126015126016126017126018126019126020126021126022126023126024126025126026126027126028126029126030126031126032126033126034126035126036126037126038126039126040126041126042126043126044126045126046126047126048126049126050126051126052126053126054126055126056126057126058126059126060126061126062126063126064126065126066126067126068126069126070126071126072126073126074126075126076126077126078126079126080126081126082126083126084126085126086126087126088126089126090126091126092126093126094126095126096126097126098126099126100126101126102126103126104126105126106126107126108126109126110126111126112126113126114126115126116126117126118126119126120126121126122126123126124126125126126126127126128126129126130126131126132126133126134126135126136126137126138126139126140126141126142126143126144126145126146126147126148126149126150126151126152126153126154126155126156126157126158126159126160126161126162126163126164126165126166126167126168126169126170126171126172126173126174126175126176126177126178126179126180126181126182126183126184126185126186126187126188126189126190126191126192126193126194126195126196126197126198126199126200126201126202126203126204126205126206126207126208126209126210126211126212126213126214126215126216126217126218126219126220126221126222126223126224126225126226126227126228126229126230126231126232126233126234126235126236126237126238126239126240126241126242126243126244126245126246126247126248126249126250126251126252126253126254126255126256126257126258126259126260126261126262126263126264126265126266126267126268126269126270126271126272126273126274126275126276126277126278126279126280126281126282126283126284126285126286126287126288126289126290126291126292126293126294126295126296126297126298126299126300126301126302126303126304126305126306126307126308126309126310126311126312126313126314126315126316126317126318126319126320126321126322126323126324126325126326126327126328126329126330126331126332126333126334126335126336126337126338126339126340126341126342126343126344126345126346126347126348126349126350126351126352126353126354126355126356126357126358126359126360126361126362126363126364126365126366126367126368126369126370126371126372126373126374126375126376126377126378126379126380126381126382126383126384126385126386126387126388126389126390126391126392126393126394126395126396126397126398126399126400126401126402126403126404126405126406126407126408126409126410126411126412126413126414126415126416126417126418126419126420126421126422126423126424126425126426126427126428126429126430126431126432126433126434126435126436126437126438126439126440126441126442126443126444126445126446126447126448126449126450126451126452126453126454126455126456126457126458126459126460126461126462126463126464126465126466126467126468126469126470126471126472126473126474126475126476126477126478126479126480126481126482126483126484126485126486126487126488126489126490126491126492126493126494126495126496126497126498126499126500126501126502126503126504126505126506126507126508126509126510126511126512126513126514126515126516126517126518126519126520126521126522126523126524126525126526126527126528126529126530126531126532126533126534126535126536126537126538126539126540126541126542126543126544126545126546126547126548126549126550126551126552126553126554126555126556126557126558126559126560126561126562126563126564126565126566126567126568126569126570126571126572126573126574126575126576126577126578126579126580126581126582126583126584126585126586126587126588126589126590126591126592126593126594126595126596126597126598126599126600126601126602126603126604126605126606126607126608126609126610126611126612126613126614126615126616126617126618126619126620126621126622126623126624126625126626126627126628126629126630126631126632126633126634126635126636126637126638126639126640126641126642126643126644126645126646126647126648126649126650126651126652126653126654126655126656126657126658126659126660126661126662126663126664126665126666126667126668126669126670126671126672126673126674126675126676126677126678126679126680126681126682126683126684126685126686126687126688126689126690126691126692126693126694126695126696126697126698126699126700126701126702126703126704126705126706126707126708126709126710126711126712126713126714126715126716126717126718126719126720126721126722126723126724126725126726126727126728126729126730126731126732126733126734126735126736126737126738126739126740126741126742126743126744126745126746126747126748126749126750126751126752126753126754126755126756126757126758126759126760126761126762126763126764126765126766126767126768126769126770126771126772126773126774126775126776126777126778126779126780126781126782126783126784126785126786126787126788126789126790126791126792126793126794126795126796126797126798126799126800126801126802126803126804126805126806126807126808126809126810126811126812126813126814126815126816126817126818126819126820126821126822126823126824126825126826126827126828126829126830126831126832126833126834126835126836126837126838126839126840126841126842126843126844126845126846126847126848126849126850126851126852126853126854126855126856126857126858126859126860126861126862126863126864126865126866126867126868126869126870126871126872126873126874126875126876126877126878126879126880126881126882126883126884126885126886126887126888126889126890126891126892126893126894126895126896126897126898126899126900126901126902126903126904126905126906126907126908126909126910126911126912126913126914126915126916126917126918126919126920126921126922126923126924126925126926126927126928126929126930126931126932126933126934126935126936126937126938126939126940126941126942126943126944126945126946126947126948126949126950126951126952126953126954126955126956126957126958126959126960126961126962126963126964126965126966126967126968126969126970126971126972126973126974126975126976126977126978126979126980126981126982126983126984126985126986126987126988126989126990126991126992126993126994126995126996126997126998126999127000127001127002127003127004127005127006127007127008127009127010127011127012127013127014127015127016127017127018127019127020127021127022127023127024127025127026127027127028127029127030127031127032127033127034127035127036127037127038127039127040127041127042127043127044127045127046127047127048127049127050127051127052127053127054127055127056127057127058127059127060127061127062127063127064127065127066127067127068127069127070127071127072127073127074127075127076127077127078127079127080127081127082127083127084127085127086127087127088127089127090127091127092127093127094127095127096127097127098127099127100127101127102127103127104127105127106127107127108127109127110127111127112127113127114127115127116127117127118127119127120127121127122127123127124127125127126127127127128127129127130127131127132127133127134127135127136127137127138127139127140127141127142127143127144127145127146127147127148127149127150127151127152127153127154127155127156127157127158127159127160127161127162127163127164127165127166127167127168127169127170127171127172127173127174127175127176127177127178127179127180127181127182127183127184127185127186127187127188127189127190127191127192127193127194127195127196127197127198127199127200127201127202127203127204127205127206127207127208127209127210127211127212127213127214127215127216127217127218127219127220127221127222127223127224127225127226127227127228127229127230127231127232127233127234127235127236127237127238127239127240127241127242127243127244127245127246127247127248127249127250127251127252127253127254127255127256127257127258127259127260127261127262127263127264127265127266127267127268127269127270127271127272127273127274127275127276127277127278127279127280127281127282127283127284127285127286127287127288127289127290127291127292127293127294127295127296127297127298127299127300127301127302127303127304127305127306127307127308127309127310127311127312127313127314127315127316127317127318127319127320127321127322127323127324127325127326127327127328127329127330127331127332127333127334127335127336127337127338127339127340127341127342127343127344127345127346127347127348127349127350127351127352127353127354127355127356127357127358127359127360127361127362127363127364127365127366127367127368127369127370127371127372127373127374127375127376127377127378127379127380127381127382127383127384127385127386127387127388127389127390127391127392127393127394127395127396127397127398127399127400127401127402127403127404127405127406127407127408127409127410127411127412127413127414127415127416127417127418127419127420127421127422127423127424127425127426127427127428127429127430127431127432127433127434127435127436127437127438127439127440127441127442127443127444127445127446127447127448127449127450127451127452127453127454127455127456127457127458127459127460127461127462127463127464127465127466127467127468127469127470127471127472127473127474127475127476127477127478127479127480127481127482127483127484127485127486127487127488127489127490127491127492127493127494127495127496127497127498127499127500127501127502127503127504127505127506127507127508127509127510127511127512127513127514127515127516127517127518127519127520127521127522127523127524127525127526127527127528127529127530127531127532127533127534127535127536127537127538127539127540127541127542127543127544127545127546127547127548127549127550127551127552127553127554127555127556127557127558127559127560127561127562127563127564127565127566127567127568127569127570127571127572127573127574127575127576127577127578127579127580127581127582127583127584127585127586127587127588127589127590127591127592127593127594127595127596127597127598127599127600127601127602127603127604127605127606127607127608127609127610127611127612127613127614127615127616127617127618127619127620127621127622127623127624127625127626127627127628127629127630127631127632127633127634127635127636127637127638127639127640127641127642127643127644127645127646127647127648127649127650127651127652127653127654127655127656127657127658127659127660127661127662127663127664127665127666127667127668127669127670127671127672127673127674127675127676127677127678127679127680127681127682127683127684127685127686127687127688127689127690127691127692127693127694127695127696127697127698127699127700127701127702127703127704127705127706127707127708127709127710127711127712127713127714127715127716127717127718127719127720127721127722127723127724127725127726127727127728127729127730127731127732127733127734127735127736127737127738127739127740127741127742127743127744127745127746127747127748127749127750127751127752127753127754127755127756127757127758127759127760127761127762127763127764127765127766127767127768127769127770127771127772127773127774127775127776127777127778127779127780127781127782127783127784127785127786127787127788127789127790127791127792127793127794127795127796127797127798127799127800127801127802127803127804127805127806127807127808127809127810127811127812127813127814127815127816127817127818127819127820127821127822127823127824127825127826127827127828127829127830127831127832127833127834127835127836127837127838127839127840127841127842127843127844127845127846127847127848127849127850127851127852127853127854127855127856127857127858127859127860127861127862127863127864127865127866127867127868127869127870127871127872127873127874127875127876127877127878127879127880127881127882127883127884127885127886127887127888127889127890127891127892127893127894127895127896127897127898127899127900127901127902127903127904127905127906127907127908127909127910127911127912127913127914127915127916127917127918127919127920127921127922127923127924127925127926127927127928127929127930127931127932127933127934127935127936127937127938127939127940127941127942127943127944127945127946127947127948127949127950127951127952127953127954127955127956127957127958127959127960127961127962127963127964127965127966127967127968127969127970127971127972127973127974127975127976127977127978127979127980127981127982127983127984127985127986127987127988127989127990127991127992127993127994127995127996127997127998127999128000128001128002128003128004128005128006128007128008128009128010128011128012128013128014128015128016128017128018128019128020128021128022128023128024128025128026128027128028128029128030128031128032128033128034128035128036128037128038128039128040128041128042128043128044128045128046128047128048128049128050128051128052128053128054128055128056128057128058128059128060128061128062128063128064128065128066128067128068128069128070128071128072128073128074128075128076128077128078128079128080128081128082128083128084128085128086128087128088128089128090128091128092128093128094128095128096128097128098128099128100128101128102128103128104128105128106128107128108128109128110128111128112128113128114128115128116128117128118128119128120128121128122128123128124128125128126128127128128128129128130128131128132128133128134128135128136128137128138128139128140128141128142128143128144128145128146128147128148128149128150128151128152128153128154128155128156128157128158128159128160128161128162128163128164128165128166128167128168128169128170128171128172128173128174128175128176128177128178128179128180128181128182128183128184128185128186128187128188128189128190128191128192128193128194128195128196128197128198128199128200128201128202128203128204128205128206128207128208128209128210128211128212128213128214128215128216128217128218128219128220128221128222128223128224128225128226128227128228128229128230128231128232128233128234128235128236128237128238128239128240128241128242128243128244128245128246128247128248128249128250128251128252128253128254128255128256128257128258128259128260128261128262128263128264128265128266128267128268128269128270128271128272128273128274128275128276128277128278128279128280128281128282128283128284128285128286128287128288128289128290128291128292128293128294128295128296128297128298128299128300128301128302128303128304128305128306128307128308128309128310128311128312128313128314128315128316128317128318128319128320128321128322128323128324128325128326128327128328128329128330128331128332128333128334128335128336128337128338128339128340128341128342128343128344128345128346128347128348128349128350128351128352128353128354128355128356128357128358128359128360128361128362128363128364128365128366128367128368128369128370128371128372128373128374128375128376128377128378128379128380128381128382128383128384128385128386128387128388128389128390128391128392128393128394128395128396128397128398128399128400128401128402128403128404128405128406128407128408128409128410128411128412128413128414128415128416128417128418128419128420128421128422128423128424128425128426128427128428128429128430128431128432128433128434128435128436128437128438128439128440128441128442128443128444128445128446128447128448128449128450128451128452128453128454128455128456128457128458128459128460128461128462128463128464128465128466128467128468128469128470128471128472128473128474128475128476128477128478128479128480128481128482128483128484128485128486128487128488128489128490128491128492128493128494128495128496128497128498128499128500128501128502128503128504128505128506128507128508128509128510128511128512128513128514128515128516128517128518128519128520128521128522128523128524128525128526128527128528128529128530128531128532128533128534128535128536128537128538128539128540128541128542128543128544128545128546128547128548128549128550128551128552128553128554128555128556128557128558128559128560128561128562128563128564128565128566128567128568128569128570128571128572128573128574128575128576128577128578128579128580128581128582128583128584128585128586128587128588128589128590128591128592128593128594128595128596128597128598128599128600128601128602128603128604128605128606128607128608128609128610128611128612128613128614128615128616128617128618128619128620128621128622128623128624128625128626128627128628128629128630128631128632128633128634128635128636128637128638128639128640128641128642128643128644128645128646128647128648128649128650128651128652128653128654128655128656128657128658128659128660128661128662128663128664128665128666128667128668128669128670128671128672128673128674128675128676128677128678128679128680128681128682128683128684128685128686128687128688128689128690128691128692128693128694128695128696128697128698128699128700128701128702128703128704128705128706128707128708128709128710128711128712128713128714128715128716128717128718128719128720128721128722128723128724128725128726128727128728128729128730128731128732128733128734128735128736128737128738128739128740128741128742128743128744128745128746128747128748128749128750128751128752128753128754128755128756128757128758128759128760128761128762128763128764128765128766128767128768128769128770128771128772128773128774128775128776128777128778128779128780128781128782128783128784128785128786128787128788128789128790128791128792128793128794128795128796128797128798128799128800128801128802128803128804128805128806128807128808128809128810128811128812128813128814128815128816128817128818128819128820128821128822128823128824128825128826128827128828128829128830128831128832128833128834128835128836128837128838128839128840128841128842128843128844128845128846128847128848128849128850128851128852128853128854128855128856128857128858128859128860128861128862128863128864128865128866128867128868128869128870128871128872128873128874128875128876128877128878128879128880128881128882128883128884128885128886128887128888128889128890128891128892128893128894128895128896128897128898128899128900128901128902128903128904128905128906128907128908128909128910128911128912128913128914128915128916128917128918128919128920128921128922128923128924128925128926128927128928128929128930128931128932128933128934128935128936128937128938128939128940128941128942128943128944128945128946128947128948128949128950128951128952128953128954128955128956128957128958128959128960128961128962128963128964128965128966128967128968128969128970128971128972128973128974128975128976128977128978128979128980128981128982128983128984128985128986128987128988128989128990128991128992128993128994128995128996128997128998128999129000129001129002129003129004129005129006129007129008129009129010129011129012129013129014129015129016129017129018129019129020129021129022129023129024129025129026129027129028129029129030129031129032129033129034129035129036129037129038129039129040129041129042129043129044129045129046129047129048129049129050129051129052129053129054129055129056129057129058129059129060129061129062129063129064129065129066129067129068129069129070129071129072129073129074129075129076129077129078129079129080129081129082129083129084129085129086129087129088129089129090129091129092129093129094129095129096129097129098129099129100129101129102129103129104129105129106129107129108129109129110129111129112129113129114129115129116129117129118129119129120129121129122129123129124129125129126129127129128129129129130129131129132129133129134129135129136129137129138129139129140129141129142129143129144129145129146129147129148129149129150129151129152129153129154129155129156129157129158129159129160129161129162129163129164129165129166129167129168129169129170129171129172129173129174129175129176129177129178129179129180129181129182129183129184129185129186129187129188129189129190129191129192129193129194129195129196129197129198129199129200129201129202129203129204129205129206129207129208129209129210129211129212129213129214129215129216129217129218129219129220129221129222129223129224129225129226129227129228129229129230129231129232129233129234129235129236129237129238129239129240129241129242129243129244129245129246129247129248129249129250129251129252129253129254129255129256129257129258129259129260129261129262129263129264129265129266129267129268129269129270129271129272129273129274129275129276129277129278129279129280129281129282129283129284129285129286129287129288129289129290129291129292129293129294129295129296129297129298129299129300129301129302129303129304129305129306129307129308129309129310129311129312129313129314129315129316129317129318129319129320129321129322129323129324129325129326129327129328129329129330129331129332129333129334129335129336129337129338129339129340129341129342129343129344129345129346129347129348129349129350129351129352129353129354129355129356129357129358129359129360129361129362129363129364129365129366129367129368129369129370129371129372129373129374129375129376129377129378129379129380129381129382129383129384129385129386129387129388129389129390129391129392129393129394129395129396129397129398129399129400129401129402129403129404129405129406129407129408129409129410129411129412129413129414129415129416129417129418129419129420129421129422129423129424129425129426129427129428129429129430129431129432129433129434129435129436129437129438129439129440129441129442129443129444129445129446129447129448129449129450129451129452129453129454129455129456129457129458129459129460129461129462129463129464129465129466129467129468129469129470129471129472129473129474129475129476129477129478129479129480129481129482129483129484129485129486129487129488129489129490129491129492129493129494129495129496129497129498129499129500129501129502129503129504129505129506129507129508129509129510129511129512129513129514129515129516129517129518129519129520129521129522129523129524129525129526129527129528129529129530129531129532129533129534129535129536129537129538129539129540129541129542129543129544129545129546129547129548129549129550129551129552129553129554129555129556129557129558129559129560129561129562129563129564129565129566129567129568129569129570129571129572129573129574129575129576129577129578129579129580129581129582129583129584129585129586129587129588129589129590129591129592129593129594129595129596129597129598129599129600129601129602129603129604129605129606129607129608129609129610129611129612129613129614129615129616129617129618129619129620129621129622129623129624129625129626129627129628129629129630129631129632129633129634129635129636129637129638129639129640129641129642129643129644129645129646129647129648129649129650129651129652129653129654129655129656129657129658129659129660129661129662129663129664129665129666129667129668129669129670129671129672129673129674129675129676129677129678129679129680129681129682129683129684129685129686129687129688129689129690129691129692129693129694129695129696129697129698129699129700129701129702129703129704129705129706129707129708129709129710129711129712129713129714129715129716129717129718129719129720129721129722129723129724129725129726129727129728129729129730129731129732129733129734129735129736129737129738129739129740129741129742129743129744129745129746129747129748129749129750129751129752129753129754129755129756129757129758129759129760129761129762129763129764129765129766129767129768129769129770129771129772129773129774129775129776129777129778129779129780129781129782129783129784129785129786129787129788129789129790129791129792129793129794129795129796129797129798129799129800129801129802129803129804129805129806129807129808129809129810129811129812129813129814129815129816129817129818129819129820129821129822129823129824129825129826129827129828129829129830129831129832129833129834129835129836129837129838129839129840129841129842129843129844129845129846129847129848129849129850129851129852129853129854129855129856129857129858129859129860129861129862129863129864129865129866129867129868129869129870129871129872129873129874129875129876129877129878129879129880129881129882129883129884129885129886129887129888129889129890129891129892129893129894129895129896129897129898129899129900129901129902129903129904129905129906129907129908129909129910129911129912129913129914129915129916129917129918129919129920129921129922129923129924129925129926129927129928129929129930129931129932129933129934129935129936129937129938129939129940129941129942129943129944129945129946129947129948129949129950129951129952129953129954129955129956129957129958129959129960129961129962129963129964129965129966129967129968129969129970129971129972129973129974129975129976129977129978129979129980129981129982129983129984129985129986129987129988129989129990129991129992129993129994129995129996129997129998129999130000130001130002130003130004130005130006130007130008130009130010130011130012130013130014130015130016130017130018130019130020130021130022130023130024130025130026130027130028130029130030130031130032130033130034130035130036130037130038130039130040130041130042130043130044130045130046130047130048130049130050130051130052130053130054130055130056130057130058130059130060130061130062130063130064130065130066130067130068130069130070130071130072130073130074130075130076130077130078130079130080130081130082130083130084130085130086130087130088130089130090130091130092130093130094130095130096130097130098130099130100130101130102130103130104130105130106130107130108130109130110130111130112130113130114130115130116130117130118130119130120130121130122130123130124130125130126130127130128130129130130130131130132130133130134130135130136130137130138130139130140130141130142130143130144130145130146130147130148130149130150130151130152130153130154130155130156130157130158130159130160130161130162130163130164130165130166130167130168130169130170130171130172130173130174130175130176130177130178130179130180130181130182130183130184130185130186130187130188130189130190130191130192130193130194130195130196130197130198130199130200130201130202130203130204130205130206130207130208130209130210130211130212130213130214130215130216130217130218130219130220130221130222130223130224130225130226130227130228130229130230130231130232130233130234130235130236130237130238130239130240130241130242130243130244130245130246130247130248130249130250130251130252130253130254130255130256130257130258130259130260130261130262130263130264130265130266130267130268130269130270130271130272130273130274130275130276130277130278130279130280130281130282130283130284130285130286130287130288130289130290130291130292130293130294130295130296130297130298130299130300130301130302130303130304130305130306130307130308130309130310130311130312130313130314130315130316130317130318130319130320130321130322130323130324130325130326130327130328130329130330130331130332130333130334130335130336130337130338130339130340130341130342130343130344130345130346130347130348130349130350130351130352130353130354130355130356130357130358130359130360130361130362130363130364130365130366130367130368130369130370130371130372130373130374130375130376130377130378130379130380130381130382130383130384130385130386130387130388130389130390130391130392130393130394130395130396130397130398130399130400130401130402130403130404130405130406130407130408130409130410130411130412130413130414130415130416130417130418130419130420130421130422130423130424130425130426130427130428130429130430130431130432130433130434130435130436130437130438130439130440130441130442130443130444130445130446130447130448130449130450130451130452130453130454130455130456130457130458130459130460130461130462130463130464130465130466130467130468130469130470130471130472130473130474130475130476130477130478130479130480130481130482130483130484130485130486130487130488130489130490130491130492130493130494130495130496130497130498130499130500130501130502130503130504130505130506130507130508130509130510130511130512130513130514130515130516130517130518130519130520130521130522130523130524130525130526130527130528130529130530130531130532130533130534130535130536130537130538130539130540130541130542130543130544130545130546130547130548130549130550130551130552130553130554130555130556130557130558130559130560130561130562130563130564130565130566130567130568130569130570130571130572130573130574130575130576130577130578130579130580130581130582130583130584130585130586130587130588130589130590130591130592130593130594130595130596130597130598130599130600130601130602130603130604130605130606130607130608130609130610130611130612130613130614130615130616130617130618130619130620130621130622130623130624130625130626130627130628130629130630130631130632130633130634130635130636130637130638130639130640130641130642130643130644130645130646130647130648130649130650130651130652130653130654130655130656130657130658130659130660130661130662130663130664130665130666130667130668130669130670130671130672130673130674130675130676130677130678130679130680130681130682130683130684130685130686130687130688130689130690130691130692130693130694130695130696130697130698130699130700130701130702130703130704130705130706130707130708130709130710130711130712130713130714130715130716130717130718130719130720130721130722130723130724130725130726130727130728130729130730130731130732130733130734130735130736130737130738130739130740130741130742130743130744130745130746130747130748130749130750130751130752130753130754130755130756130757130758130759130760130761130762130763130764130765130766130767130768130769130770130771130772130773130774130775130776130777130778130779130780130781130782130783130784130785130786130787130788130789130790130791130792130793130794130795130796130797130798130799130800130801130802130803130804130805130806130807130808130809130810130811130812130813130814130815130816130817130818130819130820130821130822130823130824130825130826130827130828130829130830130831130832130833130834130835130836130837130838130839130840130841130842130843130844130845130846130847130848130849130850130851130852130853130854130855130856130857130858130859130860130861130862130863130864130865130866130867130868130869130870130871130872130873130874130875130876130877130878130879130880130881130882130883130884130885130886130887130888130889130890130891130892130893130894130895130896130897130898130899130900130901130902130903130904130905130906130907130908130909130910130911130912130913130914130915130916130917130918130919130920130921130922130923130924130925130926130927130928130929130930130931130932130933130934130935130936130937130938130939130940130941130942130943130944130945130946130947130948130949130950130951130952130953130954130955130956130957130958130959130960130961130962130963130964130965130966130967130968130969130970130971130972130973130974130975130976130977130978130979130980130981130982130983130984130985130986130987130988130989130990130991130992130993130994130995130996130997130998130999131000131001131002131003131004131005131006131007131008131009131010131011131012131013131014131015131016131017131018131019131020131021131022131023131024131025131026131027131028131029131030131031131032131033131034131035131036131037131038131039131040131041131042131043131044131045131046131047131048131049131050131051131052131053131054131055131056131057131058131059131060131061131062131063131064131065131066131067131068131069131070131071131072131073131074131075131076131077131078131079131080131081131082131083131084131085131086131087131088131089131090131091131092131093131094131095131096131097131098131099131100131101131102131103131104131105131106131107131108131109131110131111131112131113131114131115131116131117131118131119131120131121131122131123131124131125131126131127131128131129131130131131131132131133131134131135131136131137131138131139131140131141131142131143131144131145131146131147131148131149131150131151131152131153131154131155131156131157131158131159131160131161131162131163131164131165131166131167131168131169131170131171131172131173131174131175131176131177131178131179131180131181131182131183131184131185131186131187131188131189131190131191131192131193131194131195131196131197131198131199131200131201131202131203131204131205131206131207131208131209131210131211131212131213131214131215131216131217131218131219131220131221131222131223131224131225131226131227131228131229131230131231131232131233131234131235131236131237131238131239131240131241131242131243131244131245131246131247131248131249131250131251131252131253131254131255131256131257131258131259131260131261131262131263131264131265131266131267131268131269131270131271131272131273131274131275131276131277131278131279131280131281131282131283131284131285131286131287131288131289131290131291131292131293131294131295131296131297131298131299131300131301131302131303131304131305131306131307131308131309131310131311131312131313131314131315131316131317131318131319131320131321131322131323131324131325131326131327131328131329131330131331131332131333131334131335131336131337131338131339131340131341131342131343131344131345131346131347131348131349131350131351131352131353131354131355131356131357131358131359131360131361131362131363131364131365131366131367131368131369131370131371131372131373131374131375131376131377131378131379131380131381131382131383131384131385131386131387131388131389131390131391131392131393131394131395131396131397131398131399131400131401131402131403131404131405131406131407131408131409131410131411131412131413131414131415131416131417131418131419131420131421131422131423131424131425131426131427131428131429131430131431131432131433131434131435131436131437131438131439131440131441131442131443131444131445131446131447131448131449131450131451131452131453131454131455131456131457131458131459131460131461131462131463131464131465131466131467131468131469131470131471131472131473131474131475131476131477131478131479131480131481131482131483131484131485131486131487131488131489131490131491131492131493131494131495131496131497131498131499131500131501131502131503131504131505131506131507131508131509131510131511131512131513131514131515131516131517131518131519131520131521131522131523131524131525131526131527131528131529131530131531131532131533131534131535131536131537131538131539131540131541131542131543131544131545131546131547131548131549131550131551131552131553131554131555131556131557131558131559131560131561131562131563131564131565131566131567131568131569131570131571131572131573131574131575131576131577131578131579131580131581131582131583131584131585131586131587131588131589131590131591131592131593131594131595131596131597131598131599131600131601131602131603131604131605131606131607131608131609131610131611131612131613131614131615131616131617131618131619131620131621131622131623131624131625131626131627131628131629131630131631131632131633131634131635131636131637131638131639131640131641131642131643131644131645131646131647131648131649131650131651131652131653131654131655131656131657131658131659131660131661131662131663131664131665131666131667131668131669131670131671131672131673131674131675131676131677131678131679131680131681131682131683131684131685131686131687131688131689131690131691131692131693131694131695131696131697131698131699131700131701131702131703131704131705131706131707131708131709131710131711131712131713131714131715131716131717131718131719131720131721131722131723131724131725131726131727131728131729131730131731131732131733131734131735131736131737131738131739131740131741131742131743131744131745131746131747131748131749131750131751131752131753131754131755131756131757131758131759131760131761131762131763131764131765131766131767131768131769131770131771131772131773131774131775131776131777131778131779131780131781131782131783131784131785131786131787131788131789131790131791131792131793131794131795131796131797131798131799131800131801131802131803131804131805131806131807131808131809131810131811131812131813131814131815131816131817131818131819131820131821131822131823131824131825131826131827131828131829131830131831131832131833131834131835131836131837131838131839131840131841131842131843131844131845131846131847131848131849131850131851131852131853131854131855131856131857131858131859131860131861131862131863131864131865131866131867131868131869131870131871131872131873131874131875131876131877131878131879131880131881131882131883131884131885131886131887131888131889131890131891131892131893131894131895131896131897131898131899131900131901131902131903131904131905131906131907131908131909131910131911131912131913131914131915131916131917131918131919131920131921131922131923131924131925131926131927131928131929131930131931131932131933131934131935131936131937131938131939131940131941131942131943131944131945131946131947131948131949131950131951131952131953131954131955131956131957131958131959131960131961131962131963131964131965131966131967131968131969131970131971131972131973131974131975131976131977131978131979131980131981131982131983131984131985131986131987131988131989131990131991131992131993131994131995131996131997131998131999132000132001132002132003132004132005132006132007132008132009132010132011132012132013132014132015132016132017132018132019132020132021132022132023132024132025132026132027132028132029132030132031132032132033132034132035132036132037132038132039132040132041132042132043132044132045132046132047132048132049132050132051132052132053132054132055132056132057132058132059132060132061132062132063132064132065132066132067132068132069132070132071132072132073132074132075132076132077132078132079132080132081132082132083132084132085132086132087132088132089132090132091132092132093132094132095132096132097132098132099132100132101132102132103132104132105132106132107132108132109132110132111132112132113132114132115132116132117132118132119132120132121132122132123132124132125132126132127132128132129132130132131132132132133132134132135132136132137132138132139132140132141132142132143132144132145132146132147132148132149132150132151132152132153132154132155132156132157132158132159132160132161132162132163132164132165132166132167132168132169132170132171132172132173132174132175132176132177132178132179132180132181132182132183132184132185132186132187132188132189132190132191132192132193132194132195132196132197132198132199132200132201132202132203132204132205132206132207132208132209132210132211132212132213132214132215132216132217132218132219132220132221132222132223132224132225132226132227132228132229132230132231132232132233132234132235132236132237132238132239132240132241132242132243132244132245132246132247132248132249132250132251132252132253132254132255132256132257132258132259132260132261132262132263132264132265132266132267132268132269132270132271132272132273132274132275132276132277132278132279132280132281132282132283132284132285132286132287132288132289132290132291132292132293132294132295132296132297132298132299132300132301132302132303132304132305132306132307132308132309132310132311132312132313132314132315132316132317132318132319132320132321132322132323132324132325132326132327132328132329132330132331132332132333132334132335132336132337132338132339132340132341132342132343132344132345132346132347132348132349132350132351132352132353132354132355132356132357132358132359132360132361132362132363132364132365132366132367132368132369132370132371132372132373132374132375132376132377132378132379132380132381132382132383132384132385132386132387132388132389132390132391132392132393132394132395132396132397132398132399132400132401132402132403132404132405132406132407132408132409132410132411132412132413132414132415132416132417132418132419132420132421132422132423132424132425132426132427132428132429132430132431132432132433132434132435132436132437132438132439132440132441132442132443132444132445132446132447132448132449132450132451132452132453132454132455132456132457132458132459132460132461132462132463132464132465132466132467132468132469132470132471132472132473132474132475132476132477132478132479132480132481132482132483132484132485132486132487132488132489132490132491132492132493132494132495132496132497132498132499132500132501132502132503132504132505132506132507132508132509132510132511132512132513132514132515132516132517132518132519132520132521132522132523132524132525132526132527132528132529132530132531132532132533132534132535132536132537132538132539132540132541132542132543132544132545132546132547132548132549132550132551132552132553132554132555132556132557132558132559132560132561132562132563132564132565132566132567132568132569132570132571132572132573132574132575132576132577132578132579132580132581132582132583132584132585132586132587132588132589132590132591132592132593132594132595132596132597132598132599132600132601132602132603132604132605132606132607132608132609132610132611132612132613132614132615132616132617132618132619132620132621132622132623132624132625132626132627132628132629132630132631132632132633132634132635132636132637132638132639132640132641132642132643132644132645132646132647132648132649132650132651132652132653132654132655132656132657132658132659132660132661132662132663132664132665132666132667132668132669132670132671132672132673132674132675132676132677132678132679132680132681132682132683132684132685132686132687132688132689132690132691132692132693132694132695132696132697132698132699132700132701132702132703132704132705132706132707132708132709132710132711132712132713132714132715132716132717132718132719132720132721132722132723132724132725132726132727132728132729132730132731132732132733132734132735132736132737132738132739132740132741132742132743132744132745132746132747132748132749132750132751132752132753132754132755132756132757132758132759132760132761132762132763132764132765132766132767132768132769132770132771132772132773132774132775132776132777132778132779132780132781132782132783132784132785132786132787132788132789132790132791132792132793132794132795132796132797132798132799132800132801132802132803132804132805132806132807132808132809132810132811132812132813132814132815132816132817132818132819132820132821132822132823132824132825132826132827132828132829132830132831132832132833132834132835132836132837132838132839132840132841132842132843132844132845132846132847132848132849132850132851132852132853132854132855132856132857132858132859132860132861132862132863132864132865132866132867132868132869132870132871132872132873132874132875132876132877132878132879132880132881132882132883132884132885132886132887132888132889132890132891132892132893132894132895132896132897132898132899132900132901132902132903132904132905132906132907132908132909132910132911132912132913132914132915132916132917132918132919132920132921132922132923132924132925132926132927132928132929132930132931132932132933132934132935132936132937132938132939132940132941132942132943132944132945132946132947132948132949132950132951132952132953132954132955132956132957132958132959132960132961132962132963132964132965132966132967132968132969132970132971132972132973132974132975132976132977132978132979132980132981132982132983132984132985132986132987132988132989132990132991132992132993132994132995132996132997132998132999133000133001133002133003133004133005133006133007133008133009133010133011133012133013133014133015133016133017133018133019133020133021133022133023133024133025133026133027133028133029133030133031133032133033133034133035133036133037133038133039133040133041133042133043133044133045133046133047133048133049133050133051133052133053133054133055133056133057133058133059133060133061133062133063133064133065133066133067133068133069133070133071133072133073133074133075133076133077133078133079133080133081133082133083133084133085133086133087133088133089133090133091133092133093133094133095133096133097133098133099133100133101133102133103133104133105133106133107133108133109133110133111133112133113133114133115133116133117133118133119133120133121133122133123133124133125133126133127133128133129133130133131133132133133133134133135133136133137133138133139133140133141133142133143133144133145133146133147133148133149133150133151133152133153133154133155133156133157133158133159133160133161133162133163133164133165133166133167133168133169133170133171133172133173133174133175133176133177133178133179133180133181133182133183133184133185133186133187133188133189133190133191133192133193133194133195133196133197133198133199133200133201133202133203133204133205133206133207133208133209133210133211133212133213133214133215133216133217133218133219133220133221133222133223133224133225133226133227133228133229133230133231133232133233133234133235133236133237133238133239133240133241133242133243133244133245133246133247133248133249133250133251133252133253133254133255133256133257133258133259133260133261133262133263133264133265133266133267133268133269133270133271133272133273133274133275133276133277133278133279133280133281133282133283133284133285133286133287133288133289133290133291133292133293133294133295133296133297133298133299133300133301133302133303133304133305133306133307133308133309133310133311133312133313133314133315133316133317133318133319133320133321133322133323133324133325133326133327133328133329133330133331133332133333133334133335133336133337133338133339133340133341133342133343133344133345133346133347133348133349133350133351133352133353133354133355133356133357133358133359133360133361133362133363133364133365133366133367133368133369133370133371133372133373133374133375133376133377133378133379133380133381133382133383133384133385133386133387133388133389133390133391133392133393133394133395133396133397133398133399133400133401133402133403133404133405133406133407133408133409133410133411133412133413133414133415133416133417133418133419133420133421133422133423133424133425133426133427133428133429133430133431133432133433133434133435133436133437133438133439133440133441133442133443133444133445133446133447133448133449133450133451133452133453133454133455133456133457133458133459133460133461133462133463133464133465133466133467133468133469133470133471133472133473133474133475133476133477133478133479133480133481133482133483133484133485133486133487133488133489133490133491133492133493133494133495133496133497133498133499133500133501133502133503133504133505133506133507133508133509133510133511133512133513133514133515133516133517133518133519133520133521133522133523133524133525133526133527133528133529133530133531133532133533133534133535133536133537133538133539133540133541133542133543133544133545133546133547133548133549133550133551133552133553133554133555133556133557133558133559133560133561133562133563133564133565133566133567133568133569133570133571133572133573133574133575133576133577133578133579133580133581133582133583133584133585133586133587133588133589133590133591133592133593133594133595133596133597133598133599133600133601133602133603133604133605133606133607133608133609133610133611133612133613133614133615133616133617133618133619133620133621133622133623133624133625133626133627133628133629133630133631133632133633133634133635133636133637133638133639133640133641133642133643133644133645133646133647133648133649133650133651133652133653133654133655133656133657133658133659133660133661133662133663133664133665133666133667133668133669133670133671133672133673133674133675133676133677133678133679133680133681133682133683133684133685133686133687133688133689133690133691133692133693133694133695133696133697133698133699133700133701133702133703133704133705133706133707133708133709133710133711133712133713133714133715133716133717133718133719133720133721133722133723133724133725133726133727133728133729133730133731133732133733133734133735133736133737133738133739133740133741133742133743133744133745133746133747133748133749133750133751133752133753133754133755133756133757133758133759133760133761133762133763133764133765133766133767133768133769133770133771133772133773133774133775133776133777133778133779133780133781133782133783133784133785133786133787133788133789133790133791133792133793133794133795133796133797133798133799133800133801133802133803133804133805133806133807133808133809133810133811133812133813133814133815133816133817133818133819133820133821133822133823133824133825133826133827133828133829133830133831133832133833133834133835133836133837133838133839133840133841133842133843133844133845133846133847133848133849133850133851133852133853133854133855133856133857133858133859133860133861133862133863133864133865133866133867133868133869133870133871133872133873133874133875133876133877133878133879133880133881133882133883133884133885133886133887133888133889133890133891133892133893133894133895133896133897133898133899133900133901133902133903133904133905133906133907133908133909133910133911133912133913133914133915133916133917133918133919133920133921133922133923133924133925133926133927133928133929133930133931133932133933133934133935133936133937133938133939133940133941133942133943133944133945133946133947133948133949133950133951133952133953133954133955133956133957133958133959133960133961133962133963133964133965133966133967133968133969133970133971133972133973133974133975133976133977133978133979133980133981133982133983133984133985133986133987133988133989133990133991133992133993133994133995133996133997133998133999134000134001134002134003134004134005134006134007134008134009134010134011134012134013134014134015134016134017134018134019134020134021134022134023134024134025134026134027134028134029134030134031134032134033134034134035134036134037134038134039134040134041134042134043134044134045134046134047134048134049134050134051134052134053134054134055134056134057134058134059134060134061134062134063134064134065134066134067134068134069134070134071134072134073134074134075134076134077134078134079134080134081134082134083134084134085134086134087134088134089134090134091134092134093134094134095134096134097134098134099134100134101134102134103134104134105134106134107134108134109134110134111134112134113134114134115134116134117134118134119134120134121134122134123134124134125134126134127134128134129134130134131134132134133134134134135134136134137134138134139134140134141134142134143134144134145134146134147134148134149134150134151134152134153134154134155134156134157134158134159134160134161134162134163134164134165134166134167134168134169134170134171134172134173134174134175134176134177134178134179134180134181134182134183134184134185134186134187134188134189134190134191134192134193134194134195134196134197134198134199134200134201134202134203134204134205134206134207134208134209134210134211134212134213134214134215134216134217134218134219134220134221134222134223134224134225134226134227134228134229134230134231134232134233134234134235134236134237134238134239134240134241134242134243134244134245134246134247134248134249134250134251134252134253134254134255134256134257134258134259134260134261134262134263134264134265134266134267134268134269134270134271134272134273134274134275134276134277134278134279134280134281134282134283134284134285134286134287134288134289134290134291134292134293134294134295134296134297134298134299134300134301134302134303134304134305134306134307134308134309134310134311134312134313134314134315134316134317134318134319134320134321134322134323134324134325134326134327134328134329134330134331134332134333134334134335134336134337134338134339134340134341134342134343134344134345134346134347134348134349134350134351134352134353134354134355134356134357134358134359134360134361134362134363134364134365134366134367134368134369134370134371134372134373134374134375134376134377134378134379134380134381134382134383134384134385134386134387134388134389134390134391134392134393134394134395134396134397134398134399134400134401134402134403134404134405134406134407134408134409134410134411134412134413134414134415134416134417134418134419134420134421134422134423134424134425134426134427134428134429134430134431134432134433134434134435134436134437134438134439134440134441134442134443134444134445134446134447134448134449134450134451134452134453134454134455134456134457134458134459134460134461134462134463134464134465134466134467134468134469134470134471134472134473134474134475134476134477134478134479134480134481134482134483134484134485134486134487134488134489134490134491134492134493134494134495134496134497134498134499134500134501134502134503134504134505134506134507134508134509134510134511134512134513134514134515134516134517134518134519134520134521134522134523134524134525134526134527134528134529134530134531134532134533134534134535134536134537134538134539134540134541134542134543134544134545134546134547134548134549134550134551134552134553134554134555134556134557134558134559134560134561134562134563134564134565134566134567134568134569134570134571134572134573134574134575134576134577134578134579134580134581134582134583134584134585134586134587134588134589134590134591134592134593134594134595134596134597134598134599134600134601134602134603134604134605134606134607134608134609134610134611134612134613134614134615134616134617134618134619134620134621134622134623134624134625134626134627134628134629134630134631134632134633134634134635134636134637134638134639134640134641134642134643134644134645134646134647134648134649134650134651134652134653134654134655134656134657134658134659134660134661134662134663134664134665134666134667134668134669134670134671134672134673134674134675134676134677134678134679134680134681134682134683134684134685134686134687134688134689134690134691134692134693134694134695134696134697134698134699134700134701134702134703134704134705134706134707134708134709134710134711134712134713134714134715134716134717134718134719134720134721134722134723134724134725134726134727134728134729134730134731134732134733134734134735134736134737134738134739134740134741134742134743134744134745134746134747134748134749134750134751134752134753134754134755134756134757134758134759134760134761134762134763134764134765134766134767134768134769134770134771134772134773134774134775134776134777134778134779134780134781134782134783134784134785134786134787134788134789134790134791134792134793134794134795134796134797134798134799134800134801134802134803134804134805134806134807134808134809134810134811134812134813134814134815134816134817134818134819134820134821134822134823134824134825134826134827134828134829134830134831134832134833134834134835134836134837134838134839134840134841134842134843134844134845134846134847134848134849134850134851134852134853134854134855134856134857134858134859134860134861134862134863134864134865134866134867134868134869134870134871134872134873134874134875134876134877134878134879134880134881134882134883134884134885134886134887134888134889134890134891134892134893134894134895134896134897134898134899134900134901134902134903134904134905134906134907134908134909134910134911134912134913134914134915134916134917134918134919134920134921134922134923134924134925134926134927134928134929134930134931134932134933134934134935134936134937134938134939134940134941134942134943134944134945134946134947134948134949134950134951134952134953134954134955134956134957134958134959134960134961134962134963134964134965134966134967134968134969134970134971134972134973134974134975134976134977134978134979134980134981134982134983134984134985134986134987134988134989134990134991134992134993134994134995134996134997134998134999135000135001135002135003135004135005135006135007135008135009135010135011135012135013135014135015135016135017135018135019135020135021135022135023135024135025135026135027135028135029135030135031135032135033135034135035135036135037135038135039135040135041135042135043135044135045135046135047135048135049135050135051135052135053135054135055135056135057135058135059135060135061135062135063135064135065135066135067135068135069135070135071135072135073135074135075135076135077135078135079135080135081135082135083135084135085135086135087135088135089135090135091135092135093135094135095135096135097135098135099135100135101135102135103135104135105135106135107135108135109135110135111135112135113135114135115135116135117135118135119135120135121135122135123135124135125135126135127135128135129135130135131135132135133135134135135135136135137135138135139135140135141135142135143135144135145135146135147135148135149135150135151135152135153135154135155135156135157135158135159135160135161135162135163135164135165135166135167135168135169135170135171135172135173135174135175135176135177135178135179135180135181135182135183135184135185135186135187135188135189135190135191135192135193135194135195135196135197135198135199135200135201135202135203135204135205135206135207135208135209135210135211135212135213135214135215135216135217135218135219135220135221135222135223135224135225135226135227135228135229135230135231135232135233135234135235135236135237135238135239135240135241135242135243135244135245135246135247135248135249135250135251135252135253135254135255135256135257135258135259135260135261135262135263135264135265135266135267135268135269135270135271135272135273135274135275135276135277135278135279135280135281135282135283135284135285135286135287135288135289135290135291135292135293135294135295135296135297135298135299135300135301135302135303135304135305135306135307135308135309135310135311135312135313135314135315135316135317135318135319135320135321135322135323135324135325135326135327135328135329135330135331135332135333135334135335135336135337135338135339135340135341135342135343135344135345135346135347135348135349135350135351135352135353135354135355135356135357135358135359135360135361135362135363135364135365135366135367135368135369135370135371135372135373135374135375135376135377135378135379135380135381135382135383135384135385135386135387135388135389135390135391135392135393135394135395135396135397135398135399135400135401135402135403135404135405135406135407135408135409135410135411135412135413135414135415135416135417135418135419135420135421135422135423135424135425135426135427135428135429135430135431135432135433135434135435135436135437135438135439135440135441135442135443135444135445135446135447135448135449135450135451135452135453135454135455135456135457135458135459135460135461135462135463135464135465135466135467135468135469135470135471135472135473135474135475135476135477135478135479135480135481135482135483135484135485135486135487135488135489135490135491135492135493135494135495135496135497135498135499135500135501135502135503135504135505135506135507135508135509135510135511135512135513135514135515135516135517135518135519135520135521135522135523135524135525135526135527135528135529135530135531135532135533135534135535135536135537135538135539135540135541135542135543135544135545135546135547135548135549135550135551135552135553135554135555135556135557135558135559135560135561135562135563135564135565135566135567135568135569135570135571135572135573135574135575135576135577135578135579135580135581135582135583135584135585135586135587135588135589135590135591135592135593135594135595135596135597135598135599135600135601135602135603135604135605135606135607135608135609135610135611135612135613135614135615135616135617135618135619135620135621135622135623135624135625135626135627135628135629135630135631135632135633135634135635135636135637135638135639135640135641135642135643135644135645135646135647135648135649135650135651135652135653135654135655135656135657135658135659135660135661135662135663135664135665135666135667135668135669135670135671135672135673135674135675135676135677135678135679135680135681135682135683135684135685135686135687135688135689135690135691135692135693135694135695135696135697135698135699135700135701135702135703135704135705135706135707135708135709135710135711135712135713135714135715135716135717135718135719135720135721135722135723135724135725135726135727135728135729135730135731135732135733135734135735135736135737135738135739135740135741135742135743135744135745135746135747135748135749135750135751135752135753135754135755135756135757135758135759135760135761135762135763135764135765135766135767135768135769135770135771135772135773135774135775135776135777135778135779135780135781135782135783135784135785135786135787135788135789135790135791135792135793135794135795135796135797135798135799135800135801135802135803135804135805135806135807135808135809135810135811135812135813135814135815135816135817135818135819135820135821135822135823135824135825135826135827135828135829135830135831135832135833135834135835135836135837135838135839135840135841135842135843135844135845135846135847135848135849135850135851135852135853135854135855135856135857135858135859135860135861135862135863135864135865135866135867135868135869135870135871135872135873135874135875135876135877135878135879135880135881135882135883135884135885135886135887135888135889135890135891135892135893135894135895135896135897135898135899135900135901135902135903135904135905135906135907135908135909135910135911135912135913135914135915135916135917135918135919135920135921135922135923135924135925135926135927135928135929135930135931135932135933135934135935135936135937135938135939135940135941135942135943135944135945135946135947135948135949135950135951135952135953135954135955135956135957135958135959135960135961135962135963135964135965135966135967135968135969135970135971135972135973135974135975135976135977135978135979135980135981135982135983135984135985135986135987135988135989135990135991135992135993135994135995135996135997135998135999136000136001136002136003136004136005136006136007136008136009136010136011136012136013136014136015136016136017136018136019136020136021136022136023136024136025136026136027136028136029136030136031136032136033136034136035136036136037136038136039136040136041136042136043136044136045136046136047136048136049136050136051136052136053136054136055136056136057136058136059136060136061136062136063136064136065136066136067136068136069136070136071136072136073136074136075136076136077136078136079136080136081136082136083136084136085136086136087136088136089136090136091136092136093136094136095136096136097136098136099136100136101136102136103136104136105136106136107136108136109136110136111136112136113136114136115136116136117136118136119136120136121136122136123136124136125136126136127136128136129136130136131136132136133136134136135136136136137136138136139136140136141136142136143136144136145136146136147136148136149136150136151136152136153136154136155136156136157136158136159136160136161136162136163136164136165136166136167136168136169136170136171136172136173136174136175136176136177136178136179136180136181136182136183136184136185136186136187136188136189136190136191136192136193136194136195136196136197136198136199136200136201136202136203136204136205136206136207136208136209136210136211136212136213136214136215136216136217136218136219136220136221136222136223136224136225136226136227136228136229136230136231136232136233136234136235136236136237136238136239136240136241136242136243136244136245136246136247136248136249136250136251136252136253136254136255136256136257136258136259136260136261136262136263136264136265136266136267136268136269136270136271136272136273136274136275136276136277136278136279136280136281136282136283136284136285136286136287136288136289136290136291136292136293136294136295136296136297136298136299136300136301136302136303136304136305136306136307136308136309136310136311136312136313136314136315136316136317136318136319136320136321136322136323136324136325136326136327136328136329136330136331136332136333136334136335136336136337136338136339136340136341136342136343136344136345136346136347136348136349136350136351136352136353136354136355136356136357136358136359136360136361136362136363136364136365136366136367136368136369136370136371136372136373136374136375136376136377136378136379136380136381136382136383136384136385136386136387136388136389136390136391136392136393136394136395136396136397136398136399136400136401136402136403136404136405136406136407136408136409136410136411136412136413136414136415136416136417136418136419136420136421136422136423136424136425136426136427136428136429136430136431136432136433136434136435136436136437136438136439136440136441136442136443136444136445136446136447136448136449136450136451136452136453136454136455136456136457136458136459136460136461136462136463136464136465136466136467136468136469136470136471136472136473136474136475136476136477136478136479136480136481136482136483136484136485136486136487136488136489136490136491136492136493136494136495136496136497136498136499136500136501136502136503136504136505136506136507136508136509136510136511136512136513136514136515136516136517136518136519136520136521136522136523136524136525136526136527136528136529136530136531136532136533136534136535136536136537136538136539136540136541136542136543136544136545136546136547136548136549136550136551136552136553136554136555136556136557136558136559136560136561136562136563136564136565136566136567136568136569136570136571136572136573136574136575136576136577136578136579136580136581136582136583136584136585136586136587136588136589136590136591136592136593136594136595136596136597136598136599136600136601136602136603136604136605136606136607136608136609136610136611136612136613136614136615136616136617136618136619136620136621136622136623136624136625136626136627136628136629136630136631136632136633136634136635136636136637136638136639136640136641136642136643136644136645136646136647136648136649136650136651136652136653136654136655136656136657136658136659136660136661136662136663136664136665136666136667136668136669136670136671136672136673136674136675136676136677136678136679136680136681136682136683136684136685136686136687136688136689136690136691136692136693136694136695136696136697136698136699136700136701136702136703136704136705136706136707136708136709136710136711136712136713136714136715136716136717136718136719136720136721136722136723136724136725136726136727136728136729136730136731136732136733136734136735136736136737136738136739136740136741136742136743136744136745136746136747136748136749136750136751136752136753136754136755136756136757136758136759136760136761136762136763136764136765136766136767136768136769136770136771136772136773136774136775136776136777136778136779136780136781136782136783136784136785136786136787136788136789136790136791136792136793136794136795136796136797136798136799136800136801136802136803136804136805136806136807136808136809136810136811136812136813136814136815136816136817136818136819136820136821136822136823136824136825136826136827136828136829136830136831136832136833136834136835136836136837136838136839136840136841136842136843136844136845136846136847136848136849136850136851136852136853136854136855136856136857136858136859136860136861136862136863136864136865136866136867136868136869136870136871136872136873136874136875136876136877136878136879136880136881136882136883136884136885136886136887136888136889136890136891136892136893136894136895136896136897136898136899136900136901136902136903136904136905136906136907136908136909136910136911136912136913136914136915136916136917136918136919136920136921136922136923136924136925136926136927136928136929136930136931136932136933136934136935136936136937136938136939136940136941136942136943136944136945136946136947136948136949136950136951136952136953136954136955136956136957136958136959136960136961136962136963136964136965136966136967136968136969136970136971136972136973136974136975136976136977136978136979136980136981136982136983136984136985136986136987136988136989136990136991136992136993136994136995136996136997136998136999137000137001137002137003137004137005137006137007137008137009137010137011137012137013137014137015137016137017137018137019137020137021137022137023137024137025137026137027137028137029137030137031137032137033137034137035137036137037137038137039137040137041137042137043137044137045137046137047137048137049137050137051137052137053137054137055137056137057137058137059137060137061137062137063137064137065137066137067137068137069137070137071137072137073137074137075137076137077137078137079137080137081137082137083137084137085137086137087137088137089137090137091137092137093137094137095137096137097137098137099137100137101137102137103137104137105137106137107137108137109137110137111137112137113137114137115137116137117137118137119137120137121137122137123137124137125137126137127137128137129137130137131137132137133137134137135137136137137137138137139137140137141137142137143137144137145137146137147137148137149137150137151137152137153137154137155137156137157137158137159137160137161137162137163137164137165137166137167137168137169137170137171137172137173137174137175137176137177137178137179137180137181137182137183137184137185137186137187137188137189137190137191137192137193137194137195137196137197137198137199137200137201137202137203137204137205137206137207137208137209137210137211137212137213137214137215137216137217137218137219137220137221137222137223137224137225137226137227137228137229137230137231137232137233137234137235137236137237137238137239137240137241137242137243137244137245137246137247137248137249137250137251137252137253137254137255137256137257137258137259137260137261137262137263137264137265137266137267137268137269137270137271137272137273137274137275137276137277137278137279137280137281137282137283137284137285137286137287137288137289137290137291137292137293137294137295137296137297137298137299137300137301137302137303137304137305137306137307137308137309137310137311137312137313137314137315137316137317137318137319137320137321137322137323137324137325137326137327137328137329137330137331137332137333137334137335137336137337137338137339137340137341137342137343137344137345137346137347137348137349137350137351137352137353137354137355137356137357137358137359137360137361137362137363137364137365137366137367137368137369137370137371137372137373137374137375137376137377137378137379137380137381137382137383137384137385137386137387137388137389137390137391137392137393137394137395137396137397137398137399137400137401137402137403137404137405137406137407137408137409137410137411137412137413137414137415137416137417137418137419137420137421137422137423137424137425137426137427137428137429137430137431137432137433137434137435137436137437137438137439137440137441137442137443137444137445137446137447137448137449137450137451137452137453137454137455137456137457137458137459137460137461137462137463137464137465137466137467137468137469137470137471137472137473137474137475137476137477137478137479137480137481137482137483137484137485137486137487137488137489137490137491137492137493137494137495137496137497137498137499137500137501137502137503137504137505137506137507137508137509137510137511137512137513137514137515137516137517137518137519137520137521137522137523137524137525137526137527137528137529137530137531137532137533137534137535137536137537137538137539137540137541137542137543137544137545137546137547137548137549137550137551137552137553137554137555137556137557137558137559137560137561137562137563137564137565137566137567137568137569137570137571137572137573137574137575137576137577137578137579137580137581137582137583137584137585137586137587137588137589137590137591137592137593137594137595137596137597137598137599137600137601137602137603137604137605137606137607137608137609137610137611137612137613137614137615137616137617137618137619137620137621137622137623137624137625137626137627137628137629137630137631137632137633137634137635137636137637137638137639137640137641137642137643137644137645137646137647137648137649137650137651137652137653137654137655137656137657137658137659137660137661137662137663137664137665137666137667137668137669137670137671137672137673137674137675137676137677137678137679137680137681137682137683137684137685137686137687137688137689137690137691137692137693137694137695137696137697137698137699137700137701137702137703137704137705137706137707137708137709137710137711137712137713137714137715137716137717137718137719137720137721137722137723137724137725137726137727137728137729137730137731137732137733137734137735137736137737137738137739137740137741137742137743137744137745137746137747137748137749137750137751137752137753137754137755137756137757137758137759137760137761137762137763137764137765137766137767137768137769137770137771137772137773137774137775137776137777137778137779137780137781137782137783137784137785137786137787137788137789137790137791137792137793137794137795137796137797137798137799137800137801137802137803137804137805137806137807137808137809137810137811137812137813137814137815137816137817137818137819137820137821137822137823137824137825137826137827137828137829137830137831137832137833137834137835137836137837137838137839137840137841137842137843137844137845137846137847137848137849137850137851137852137853137854137855137856137857137858137859137860137861137862137863137864137865137866137867137868137869137870137871137872137873137874137875137876137877137878137879137880137881137882137883137884137885137886137887137888137889137890137891137892137893137894137895137896137897137898137899137900137901137902137903137904137905137906137907137908137909137910137911137912137913137914137915137916137917137918137919137920137921137922137923137924137925137926137927137928137929137930137931137932137933137934137935137936137937137938137939137940137941137942137943137944137945137946137947137948137949137950137951137952137953137954137955137956137957137958137959137960137961137962137963137964137965137966137967137968137969137970137971137972137973137974137975137976137977137978137979137980137981137982137983137984137985137986137987137988137989137990137991137992137993137994137995137996137997137998137999138000138001138002138003138004138005138006138007138008138009138010138011138012138013138014138015138016138017138018138019138020138021138022138023138024138025138026138027138028138029138030138031138032138033138034138035138036138037138038138039138040138041138042138043138044138045138046138047138048138049138050138051138052138053138054138055138056138057138058138059138060138061138062138063138064138065138066138067138068138069138070138071138072138073138074138075138076138077138078138079138080138081138082138083138084138085138086138087138088138089138090138091138092138093138094138095138096138097138098138099138100138101138102138103138104138105138106138107138108138109138110138111138112138113138114138115138116138117138118138119138120138121138122138123138124138125138126138127138128138129138130138131138132138133138134138135138136138137138138138139138140138141138142138143138144138145138146138147138148138149138150138151138152138153138154138155138156138157138158138159138160138161138162138163138164138165138166138167138168138169138170138171138172138173138174138175138176138177138178138179138180138181138182138183138184138185138186138187138188138189138190138191138192138193138194138195138196138197138198138199138200138201138202138203138204138205138206138207138208138209138210138211138212138213138214138215138216138217138218138219138220138221138222138223138224138225138226138227138228138229138230138231138232138233138234138235138236138237138238138239138240138241138242138243138244138245138246138247138248138249138250138251138252138253138254138255138256138257138258138259138260138261138262138263138264138265138266138267138268138269138270138271138272138273138274138275138276138277138278138279138280138281138282138283138284138285138286138287138288138289138290138291138292138293138294138295138296138297138298138299138300138301138302138303138304138305138306138307138308138309138310138311138312138313138314138315138316138317138318138319138320138321138322138323138324138325138326138327138328138329138330138331138332138333138334138335138336138337138338138339138340138341138342138343138344138345138346138347138348138349138350138351138352138353138354138355138356138357138358138359138360138361138362138363138364138365138366138367138368138369138370138371138372138373138374138375138376138377138378138379138380138381138382138383138384138385138386138387138388138389138390138391138392138393138394138395138396138397138398138399138400138401138402138403138404138405138406138407138408138409138410138411138412138413138414138415138416138417138418138419138420138421138422138423138424138425138426138427138428138429138430138431138432138433138434138435138436138437138438138439138440138441138442138443138444138445138446138447138448138449138450138451138452138453138454138455138456138457138458138459138460138461138462138463138464138465138466138467138468138469138470138471138472138473138474138475138476138477138478138479138480138481138482138483138484138485138486138487138488138489138490138491138492138493138494138495138496138497138498138499138500138501138502138503138504138505138506138507138508138509138510138511138512138513138514138515138516138517138518138519138520138521138522138523138524138525138526138527138528138529138530138531138532138533138534138535138536138537138538138539138540138541138542138543138544138545138546138547138548138549138550138551138552138553138554138555138556138557138558138559138560138561138562138563138564138565138566138567138568138569138570138571138572138573138574138575138576138577138578138579138580138581138582138583138584138585138586138587138588138589138590138591138592138593138594138595138596138597138598138599138600138601138602138603138604138605138606138607138608138609138610138611138612138613138614138615138616138617138618138619138620138621138622138623138624138625138626138627138628138629138630138631138632138633138634138635138636138637138638138639138640138641138642138643138644138645138646138647138648138649138650138651138652138653138654138655138656138657138658138659138660138661138662138663138664138665138666138667138668138669138670138671138672138673138674138675138676138677138678138679138680138681138682138683138684138685138686138687138688138689138690138691138692138693138694138695138696138697138698138699138700138701138702138703138704138705138706138707138708138709138710138711138712138713138714138715138716138717138718138719138720138721138722138723138724138725138726138727138728138729138730138731138732138733138734138735138736138737138738138739138740138741138742138743138744138745138746138747138748138749138750138751138752138753138754138755138756138757138758138759138760138761138762138763138764138765138766138767138768138769138770138771138772138773138774138775138776138777138778138779138780138781138782138783138784138785138786138787138788138789138790138791138792138793138794138795138796138797138798138799138800138801138802138803138804138805138806138807138808138809138810138811138812138813138814138815138816138817138818138819138820138821138822138823138824138825138826138827138828138829138830138831138832138833138834138835138836138837138838138839138840138841138842138843138844138845138846138847138848138849138850138851138852138853138854138855138856138857138858138859138860138861138862138863138864138865138866138867138868138869138870138871138872138873138874138875138876138877138878138879138880138881138882138883138884138885138886138887138888138889138890138891138892138893138894138895138896138897138898138899138900138901138902138903138904138905138906138907138908138909138910138911138912138913138914138915138916138917138918138919138920138921138922138923138924138925138926138927138928138929138930138931138932138933138934138935138936138937138938138939138940138941138942138943138944138945138946138947138948138949138950138951138952138953138954138955138956138957138958138959138960138961138962138963138964138965138966138967138968138969138970138971138972138973138974138975138976138977138978138979138980138981138982138983138984138985138986138987138988138989138990138991138992138993138994138995138996138997138998138999139000139001139002139003139004139005139006139007139008139009139010139011139012139013139014139015139016139017139018139019139020139021139022139023139024139025139026139027139028139029139030139031139032139033139034139035139036139037139038139039139040139041139042139043139044139045139046139047139048139049139050139051139052139053139054139055139056139057139058139059139060139061139062139063139064139065139066139067139068139069139070139071139072139073139074139075139076139077139078139079139080139081139082139083139084139085139086139087139088139089139090139091139092139093139094139095139096139097139098139099139100139101139102139103139104139105139106139107139108139109139110139111139112139113139114139115139116139117139118139119139120139121139122139123139124139125139126139127139128139129139130139131139132139133139134139135139136139137139138139139139140139141139142139143139144139145139146139147139148139149139150139151139152139153139154139155139156139157139158139159139160139161139162139163139164139165139166139167139168139169139170139171139172139173139174139175139176139177139178139179139180139181139182139183139184139185139186139187139188139189139190139191139192139193139194139195139196139197139198139199139200139201139202139203139204139205139206139207139208139209139210139211139212139213139214139215139216139217139218139219139220139221139222139223139224139225139226139227139228139229139230139231139232139233139234139235139236139237139238139239139240139241139242139243139244139245139246139247139248139249139250139251139252139253139254139255139256139257139258139259139260139261139262139263139264139265139266139267139268139269139270139271139272139273139274139275139276139277139278139279139280139281139282139283139284139285139286139287139288139289139290139291139292139293139294139295139296139297139298139299139300139301139302139303139304139305139306139307139308139309139310139311139312139313139314139315139316139317139318139319139320139321139322139323139324139325139326139327139328139329139330139331139332139333139334139335139336139337139338139339139340139341139342139343139344139345139346139347139348139349139350139351139352139353139354139355139356139357139358139359139360139361139362139363139364139365139366139367139368139369139370139371139372139373139374139375139376139377139378139379139380139381139382139383139384139385139386139387139388139389139390139391139392139393139394139395139396139397139398139399139400139401139402139403139404139405139406139407139408139409139410139411139412139413139414139415139416139417139418139419139420139421139422139423139424139425139426139427139428139429139430139431139432139433139434139435139436139437139438139439139440139441139442139443139444139445139446139447139448139449139450139451139452139453139454139455139456139457139458139459139460139461139462139463139464139465139466139467139468139469139470139471139472139473139474139475139476139477139478139479139480139481139482139483139484139485139486139487139488139489139490139491139492139493139494139495139496139497139498139499139500139501139502139503139504139505139506139507139508139509139510139511139512139513139514139515139516139517139518139519139520139521139522139523139524139525139526139527139528139529139530139531139532139533139534139535139536139537139538139539139540139541139542139543139544139545139546139547139548139549139550139551139552139553139554139555139556139557139558139559139560139561139562139563139564139565139566139567139568139569139570139571139572139573139574139575139576139577139578139579139580139581139582139583139584139585139586139587139588139589139590139591139592139593139594139595139596139597139598139599139600139601139602139603139604139605139606139607139608139609139610139611139612139613139614139615139616139617139618139619139620139621139622139623139624139625139626139627139628139629139630139631139632139633139634139635139636139637139638139639139640139641139642139643139644139645139646139647139648139649139650139651139652139653139654139655139656139657139658139659139660139661139662139663139664139665139666139667139668139669139670139671139672139673139674139675139676139677139678139679139680139681139682139683139684139685139686139687139688139689139690139691139692139693139694139695139696139697139698139699139700139701139702139703139704139705139706139707139708139709139710139711139712139713139714139715139716139717139718139719139720139721139722139723139724139725139726139727139728139729139730139731139732139733139734139735139736139737139738139739139740139741139742139743139744139745139746139747139748139749139750139751139752139753139754139755139756139757139758139759139760139761139762139763139764139765139766139767139768139769139770139771139772139773139774139775139776139777139778139779139780139781139782139783139784139785139786139787139788139789139790139791139792139793139794139795139796139797139798139799139800139801139802139803139804139805139806139807139808139809139810139811139812139813139814139815139816139817139818139819139820139821139822139823139824139825139826139827139828139829139830139831139832139833139834139835139836139837139838139839139840139841139842139843139844139845139846139847139848139849139850139851139852139853139854139855139856139857139858139859139860139861139862139863139864139865139866139867139868139869139870139871139872139873139874139875139876139877139878139879139880139881139882139883139884139885139886139887139888139889139890139891139892139893139894139895139896139897139898139899139900139901139902139903139904139905139906139907139908139909139910139911139912139913139914139915139916139917139918139919139920139921139922139923139924139925139926139927139928139929139930139931139932139933139934139935139936139937139938139939139940139941139942139943139944139945139946139947139948139949139950139951139952139953139954139955139956139957139958139959139960139961139962139963139964139965139966139967139968139969139970139971139972139973139974139975139976139977139978139979139980139981139982139983139984139985139986139987139988139989139990139991139992139993139994139995139996139997139998139999140000140001140002140003140004140005140006140007140008140009140010140011140012140013140014140015140016140017140018140019140020140021140022140023140024140025140026140027140028140029140030140031140032140033140034140035140036140037140038140039140040140041140042140043140044140045140046140047140048140049140050140051140052140053140054140055140056140057140058140059140060140061140062140063140064140065140066140067140068140069140070140071140072140073140074140075140076140077140078140079140080140081140082140083140084140085140086140087140088140089140090140091140092140093140094140095140096140097140098140099140100140101140102140103140104140105140106140107140108140109140110140111140112140113140114140115140116140117140118140119140120140121140122140123140124140125140126140127140128140129140130140131140132140133140134140135140136140137140138140139140140140141140142140143140144140145140146140147140148140149140150140151140152140153140154140155140156140157140158140159140160140161140162140163140164140165140166140167140168140169140170140171140172140173140174140175140176140177140178140179140180140181140182140183140184140185140186140187140188140189140190140191140192140193140194140195140196140197140198140199140200140201140202140203140204140205140206140207140208140209140210140211140212140213140214140215140216140217140218140219140220140221140222140223140224140225140226140227140228140229140230140231140232140233140234140235140236140237140238140239140240140241140242140243140244140245140246140247140248140249140250140251140252140253140254140255140256140257140258140259140260140261140262140263140264140265140266140267140268140269140270140271140272140273140274140275140276140277140278140279140280140281140282140283140284140285140286140287140288140289140290140291140292140293140294140295140296140297140298140299140300140301140302140303140304140305140306140307140308140309140310140311140312140313140314140315140316140317140318140319140320140321140322140323140324140325140326140327140328140329140330140331140332140333140334140335140336140337140338140339140340140341140342140343140344140345140346140347140348140349140350140351140352140353140354140355140356140357140358140359140360140361140362140363140364140365140366140367140368140369140370140371140372140373140374140375140376140377140378140379140380140381140382140383140384140385140386140387140388140389140390140391140392140393140394140395140396140397140398140399140400140401140402140403140404140405140406140407140408140409140410140411140412140413140414140415140416140417140418140419140420140421140422140423140424140425140426140427140428140429140430140431140432140433140434140435140436140437140438140439140440140441140442140443140444140445140446140447140448140449140450140451140452140453140454140455140456140457140458140459140460140461140462140463140464140465140466140467140468140469140470140471140472140473140474140475140476140477140478140479140480140481140482140483140484140485140486140487140488140489140490140491140492140493140494140495140496140497140498140499140500140501140502140503140504140505140506140507140508140509140510140511140512140513140514140515140516140517140518140519140520140521140522140523140524140525140526140527140528140529140530140531140532140533140534140535140536140537140538140539140540140541140542140543140544140545140546140547140548140549140550140551140552140553140554140555140556140557140558140559140560140561140562140563140564140565140566140567140568140569140570140571140572140573140574140575140576140577140578140579140580140581140582140583140584140585140586140587140588140589140590140591140592140593140594140595140596140597140598140599140600140601140602140603140604140605140606140607140608140609140610140611140612140613140614140615140616140617140618140619140620140621140622140623140624140625140626140627140628140629140630140631140632140633140634140635140636140637140638140639140640140641140642140643140644140645140646140647140648140649140650140651140652140653140654140655140656140657140658140659140660140661140662140663140664140665140666140667140668140669140670140671140672140673140674140675140676140677140678140679140680140681140682140683140684140685140686140687140688140689140690140691140692140693140694140695140696140697140698140699140700140701140702140703140704140705140706140707140708140709140710140711140712140713140714140715140716140717140718140719140720140721140722140723140724140725140726140727140728140729140730140731140732140733140734140735140736140737140738140739140740140741140742140743140744140745140746140747140748140749140750140751140752140753140754140755140756140757140758140759140760140761140762140763140764140765140766140767140768140769140770140771140772140773140774140775140776140777140778140779140780140781140782140783140784140785140786140787140788140789140790140791140792140793140794140795140796140797140798140799140800140801140802140803140804140805140806140807140808140809140810140811140812140813140814140815140816140817140818140819140820140821140822140823140824140825140826140827140828140829140830140831140832140833140834140835140836140837140838140839140840140841140842140843140844140845140846140847140848140849140850140851140852140853140854140855140856140857140858140859140860140861140862140863140864140865140866140867140868140869140870140871140872140873140874140875140876140877140878140879140880140881140882140883140884140885140886140887140888140889140890140891140892140893140894140895140896140897140898140899140900140901140902140903140904140905140906140907140908140909140910140911140912140913140914140915140916140917140918140919140920140921140922140923140924140925140926140927140928140929140930140931140932140933140934140935140936140937140938140939140940140941140942140943140944140945140946140947140948140949140950140951140952140953140954140955140956140957140958140959140960140961140962140963140964140965140966140967140968140969140970140971140972140973140974140975140976140977140978140979140980140981140982140983140984140985140986140987140988140989140990140991140992140993140994140995140996140997140998140999141000141001141002141003141004141005141006141007141008141009141010141011141012141013141014141015141016141017141018141019141020141021141022141023141024141025141026141027141028141029141030141031141032141033141034141035141036141037141038141039141040141041141042141043141044141045141046141047141048141049141050141051141052141053141054141055141056141057141058141059141060141061141062141063141064141065141066141067141068141069141070141071141072141073141074141075141076141077141078141079141080141081141082141083141084141085141086141087141088141089141090141091141092141093141094141095141096141097141098141099141100141101141102141103141104141105141106141107141108141109141110141111141112141113141114141115141116141117141118141119141120141121141122141123141124141125141126141127141128141129141130141131141132141133141134141135141136141137141138141139141140141141141142141143141144141145141146141147141148141149141150141151141152141153141154141155141156141157141158141159141160141161141162141163141164141165141166141167141168141169141170141171141172141173141174141175141176141177141178141179141180141181141182141183141184141185141186141187141188141189141190141191141192141193141194141195141196141197141198141199141200141201141202141203141204141205141206141207141208141209141210141211141212141213141214141215141216141217141218141219141220141221141222141223141224141225141226141227141228141229141230141231141232141233141234141235141236141237141238141239141240141241141242141243141244141245141246141247141248141249141250141251141252141253141254141255141256141257141258141259141260141261141262141263141264141265141266141267141268141269141270141271141272141273141274141275141276141277141278141279141280141281141282141283141284141285141286141287141288141289141290141291141292141293141294141295141296141297141298141299141300141301141302141303141304141305141306141307141308141309141310141311141312141313141314141315141316141317141318141319141320141321141322141323141324141325141326141327141328141329141330141331141332141333141334141335141336141337141338141339141340141341141342141343141344141345141346141347141348141349141350141351141352141353141354141355141356141357141358141359141360141361141362141363141364141365141366141367141368141369141370141371141372141373141374141375141376141377141378141379141380141381141382141383141384141385141386141387141388141389141390141391141392141393141394141395141396141397141398141399141400141401141402141403141404141405141406141407141408141409141410141411141412141413141414141415141416141417141418141419141420141421141422141423141424141425141426141427141428141429141430141431141432141433141434141435141436141437141438141439141440141441141442141443141444141445141446141447141448141449141450141451141452141453141454141455141456141457141458141459141460141461141462141463141464141465141466141467141468141469141470141471141472141473141474141475141476141477141478141479141480141481141482141483141484141485141486141487141488141489141490141491141492141493141494141495141496141497141498141499141500141501141502141503141504141505141506141507141508141509141510141511141512141513141514141515141516141517141518141519141520141521141522141523141524141525141526141527141528141529141530141531141532141533141534141535141536141537141538141539141540141541141542141543141544141545141546141547141548141549141550141551141552141553141554141555141556141557141558141559141560141561141562141563141564141565141566141567141568141569141570141571141572141573141574141575141576141577141578141579141580141581141582141583141584141585141586141587141588141589141590141591141592141593141594141595141596141597141598141599141600141601141602141603141604141605141606141607141608141609141610141611141612141613141614141615141616141617141618141619141620141621141622141623141624141625141626141627141628141629141630141631141632141633141634141635141636141637141638141639141640141641141642141643141644141645141646141647141648141649141650141651141652141653141654141655141656141657141658141659141660141661141662141663141664141665141666141667141668141669141670141671141672141673141674141675141676141677141678141679141680141681141682141683141684141685141686141687141688141689141690141691141692141693141694141695141696141697141698141699141700141701141702141703141704141705141706141707141708141709141710141711141712141713141714141715141716141717141718141719141720141721141722141723141724141725141726141727141728141729141730141731141732141733141734141735141736141737141738141739141740141741141742141743141744141745141746141747141748141749141750141751141752141753141754141755141756141757141758141759141760141761141762141763141764141765141766141767141768141769141770141771141772141773141774141775141776141777141778141779141780141781141782141783141784141785141786141787141788141789141790141791141792141793141794141795141796141797141798141799141800141801141802141803141804141805141806141807141808141809141810141811141812141813141814141815141816141817141818141819141820141821141822141823141824141825141826141827141828141829141830141831141832141833141834141835141836141837141838141839141840141841141842141843141844141845141846141847141848141849141850141851141852141853141854141855141856141857141858141859141860141861141862141863141864141865141866141867141868141869141870141871141872141873141874141875141876141877141878141879141880141881141882141883141884141885141886141887141888141889141890141891141892141893141894141895141896141897141898141899141900141901141902141903141904141905141906141907141908141909141910141911141912141913141914141915141916141917141918141919141920141921141922141923141924141925141926141927141928141929141930141931141932141933141934141935141936141937141938141939141940141941141942141943141944141945141946141947141948141949141950141951141952141953141954141955141956141957141958141959141960141961141962141963141964141965141966141967141968141969141970141971141972141973141974141975141976141977141978141979141980141981141982141983141984141985141986141987141988141989141990141991141992141993141994141995141996141997141998141999142000142001142002142003142004142005142006142007142008142009142010142011142012142013142014142015142016142017142018142019142020142021142022142023142024142025142026142027142028142029142030142031142032142033142034142035142036142037142038142039142040142041142042142043142044142045142046142047142048142049142050142051142052142053142054142055142056142057142058142059142060142061142062142063142064142065142066142067142068142069142070142071142072142073142074142075142076142077142078142079142080142081142082142083142084142085142086142087142088142089142090142091142092142093142094142095142096142097142098142099142100142101142102142103142104142105142106142107142108142109142110142111142112142113142114142115142116142117142118142119142120142121142122142123142124142125142126142127142128142129142130142131142132142133142134142135142136142137142138142139142140142141142142142143142144142145142146142147142148142149142150142151142152142153142154142155142156142157142158142159142160142161142162142163142164142165142166142167142168142169142170142171142172142173142174142175142176142177142178142179142180142181142182142183142184142185142186142187142188142189142190142191142192142193142194142195142196142197142198142199142200142201142202142203142204142205142206142207142208142209142210142211142212142213142214142215142216142217142218142219142220142221142222142223142224142225142226142227142228142229142230142231142232142233142234142235142236142237142238142239142240142241142242142243142244142245142246142247142248142249142250142251142252142253142254142255142256142257142258142259142260142261142262142263142264142265142266142267142268142269142270142271142272142273142274142275142276142277142278142279142280142281142282142283142284142285142286142287142288142289142290142291142292142293142294142295142296142297142298142299142300142301142302142303142304142305142306142307142308142309142310142311142312142313142314142315142316142317142318142319142320142321142322142323142324142325142326142327142328142329142330142331142332142333142334142335142336142337142338142339142340142341142342142343142344142345142346142347142348142349142350142351142352142353142354142355142356142357142358142359142360142361142362142363142364142365142366142367142368142369142370142371142372142373142374142375142376142377142378142379142380142381142382142383142384142385142386142387142388142389142390142391142392142393142394142395142396142397142398142399142400142401142402142403142404142405142406142407142408142409142410142411142412142413142414142415142416142417142418142419142420142421142422142423142424142425142426142427142428142429142430142431142432142433142434142435142436142437142438142439142440142441142442142443142444142445142446142447142448142449142450142451142452142453142454142455142456142457142458142459142460142461142462142463142464142465142466142467142468142469142470142471142472142473142474142475142476142477142478142479142480142481142482142483142484142485142486142487142488142489142490142491142492142493142494142495142496142497142498142499142500142501142502142503142504142505142506142507142508142509142510142511142512142513142514142515142516142517142518142519142520142521142522142523142524142525142526142527142528142529142530142531142532142533142534142535142536142537142538142539142540142541142542142543142544142545142546142547142548142549142550142551142552142553142554142555142556142557142558142559142560142561142562142563142564142565142566142567142568142569142570142571142572142573142574142575142576142577142578142579142580142581142582142583142584142585142586142587142588142589142590142591142592142593142594142595142596142597142598142599142600142601142602142603142604142605142606142607142608142609142610142611142612142613142614142615142616142617142618142619142620142621142622142623142624142625142626142627142628142629142630142631142632142633142634142635142636142637142638142639142640142641142642142643142644142645142646142647142648142649142650142651142652142653142654142655142656142657142658142659142660142661142662142663142664142665142666142667142668142669142670142671142672142673142674142675142676142677142678142679142680142681142682142683142684142685142686142687142688142689142690142691142692142693142694142695142696142697142698142699142700142701142702142703142704142705142706142707142708142709142710142711142712142713142714142715142716142717142718142719142720142721142722142723142724142725142726142727142728142729142730142731142732142733142734142735142736142737142738142739142740142741142742142743142744142745142746142747142748142749142750142751142752142753142754142755142756142757142758142759142760142761142762142763142764142765142766142767142768142769142770142771142772142773142774142775142776142777142778142779142780142781142782142783142784142785142786142787142788142789142790142791142792142793142794142795142796142797142798142799142800142801142802142803142804142805142806142807142808142809142810142811142812142813142814142815142816142817142818142819142820142821142822142823142824142825142826142827142828142829142830142831142832142833142834142835142836142837142838142839142840142841142842142843142844142845142846142847142848142849142850142851142852142853142854142855142856142857142858142859142860142861142862142863142864142865142866142867142868142869142870142871142872142873142874142875142876142877142878142879142880142881142882142883142884142885142886142887142888142889142890142891142892142893142894142895142896142897142898142899142900142901142902142903142904142905142906142907142908142909142910142911142912142913142914142915142916142917142918142919142920142921142922142923142924142925142926142927142928142929142930142931142932142933142934142935142936142937142938142939142940142941142942142943142944142945142946142947142948142949142950142951142952142953142954142955142956142957142958142959142960142961142962142963142964142965142966142967142968142969142970142971142972142973142974142975142976142977142978142979142980142981142982142983142984142985142986142987142988142989142990142991142992142993142994142995142996142997142998142999143000143001143002143003143004143005143006143007143008143009143010143011143012143013143014143015143016143017143018143019143020143021143022143023143024143025143026143027143028143029143030143031143032143033143034143035143036143037143038143039143040143041143042143043143044143045143046143047143048143049143050143051143052143053143054143055143056143057143058143059143060143061143062143063143064143065143066143067143068143069143070143071143072143073143074143075143076143077143078143079143080143081143082143083143084143085143086143087143088143089143090143091143092143093143094143095143096143097143098143099143100143101143102143103143104143105143106143107143108143109143110143111143112143113143114143115143116143117143118143119143120143121143122143123143124143125143126143127143128143129143130143131143132143133143134143135143136143137143138143139143140143141143142143143143144143145143146143147143148143149143150143151143152143153143154143155143156143157143158143159143160143161143162143163143164143165143166143167143168143169143170143171143172143173143174143175143176143177143178143179143180143181143182143183143184143185143186143187143188143189143190143191143192143193143194143195143196143197143198143199143200143201143202143203143204143205143206143207143208143209143210143211143212143213143214143215143216143217143218143219143220143221143222143223143224143225143226143227143228143229143230143231143232143233143234143235143236143237143238143239143240143241143242143243143244143245143246143247143248143249143250143251143252143253143254143255143256143257143258143259143260143261143262143263143264143265143266143267143268143269143270143271143272143273143274143275143276143277143278143279143280143281143282143283143284143285143286143287143288143289143290143291143292143293143294143295143296143297143298143299143300143301143302143303143304143305143306143307143308143309143310143311143312143313143314143315143316143317143318143319143320143321143322143323143324143325143326143327143328143329143330143331143332143333143334143335143336143337143338143339143340143341143342143343143344143345143346143347143348143349143350143351143352143353143354143355143356143357143358143359143360143361143362143363143364143365143366143367143368143369143370143371143372143373143374143375143376143377143378143379143380143381143382143383143384143385143386143387143388143389143390143391143392143393143394143395143396143397143398143399143400143401143402143403143404143405143406143407143408143409143410143411143412143413143414143415143416143417143418143419143420143421143422143423143424143425143426143427143428143429143430143431143432143433143434143435143436143437143438143439143440143441143442143443143444143445143446143447143448143449143450143451143452143453143454143455143456143457143458143459143460143461143462143463143464143465143466143467143468143469143470143471143472143473143474143475143476143477143478143479143480143481143482143483143484143485143486143487143488143489143490143491143492143493143494143495143496143497143498143499143500143501143502143503143504143505143506143507143508143509143510143511143512143513143514143515143516143517143518143519143520143521143522143523143524143525143526143527143528143529143530143531143532143533143534143535143536143537143538143539143540143541143542143543143544143545143546143547143548143549143550143551143552143553143554143555143556143557143558143559143560143561143562143563143564143565143566143567143568143569143570143571143572143573143574143575143576143577143578143579143580143581143582143583143584143585143586143587143588143589143590143591143592143593143594143595143596143597143598143599143600143601143602143603143604143605143606143607143608143609143610143611143612143613143614143615143616143617143618143619143620143621143622143623143624143625143626143627143628143629143630143631143632143633143634143635143636143637143638143639143640143641143642143643143644143645143646143647143648143649143650143651143652143653143654143655143656143657143658143659143660143661143662143663143664143665143666143667143668143669143670143671143672143673143674143675143676143677143678143679143680143681143682143683143684143685143686143687143688143689143690143691143692143693143694143695143696143697143698143699143700143701143702143703143704143705143706143707143708143709143710143711143712143713143714143715143716143717143718143719143720143721143722143723143724143725143726143727143728143729143730143731143732143733143734143735143736143737143738143739143740143741143742143743143744143745143746143747143748143749143750143751143752143753143754143755143756143757143758143759143760143761143762143763143764143765143766143767143768143769143770143771143772143773143774143775143776143777143778143779143780143781143782143783143784143785143786143787143788143789143790143791143792143793143794143795143796143797143798143799143800143801143802143803143804143805143806143807143808143809143810143811143812143813143814143815143816143817143818143819143820143821143822143823143824143825143826143827143828143829143830143831143832143833143834143835143836143837143838143839143840143841143842143843143844143845143846143847143848143849143850143851143852143853143854143855143856143857143858143859143860143861143862143863143864143865143866143867143868143869143870143871143872143873143874143875143876143877143878143879143880143881143882143883143884143885143886143887143888143889143890143891143892143893143894143895143896143897143898143899143900143901143902143903143904143905143906143907143908143909143910143911143912143913143914143915143916143917143918143919143920143921143922143923143924143925143926143927143928143929143930143931143932143933143934143935143936143937143938143939143940143941143942143943143944143945143946143947143948143949143950143951143952143953143954143955143956143957143958143959143960143961143962143963143964143965143966143967143968143969143970143971143972143973143974143975143976143977143978143979143980143981143982143983143984143985143986143987143988143989143990143991143992143993143994143995143996143997143998143999144000144001144002144003144004144005144006144007144008144009144010144011144012144013144014144015144016144017144018144019144020144021144022144023144024144025144026144027144028144029144030144031144032144033144034144035144036144037144038144039144040144041144042144043144044144045144046144047144048144049144050144051144052144053144054144055144056144057144058144059144060144061144062144063144064144065144066144067144068144069144070144071144072144073144074144075144076144077144078144079144080144081144082144083144084144085144086144087144088144089144090144091144092144093144094144095144096144097144098144099144100144101144102144103144104144105144106144107144108144109144110144111144112144113144114144115144116144117144118144119144120144121144122144123144124144125144126144127144128144129144130144131144132144133144134144135144136144137144138144139144140144141144142144143144144144145144146144147144148144149144150144151144152144153144154144155144156144157144158144159144160144161144162144163144164144165144166144167144168144169144170144171144172144173144174144175144176144177144178144179144180144181144182144183144184144185144186144187144188144189144190144191144192144193144194144195144196144197144198144199144200144201144202144203144204144205144206144207144208144209144210144211144212144213144214144215144216144217144218144219144220144221144222144223144224144225144226144227144228144229144230144231144232144233144234144235144236144237144238144239144240144241144242144243144244144245144246144247144248144249144250144251144252144253144254144255144256144257144258144259144260144261144262144263144264144265144266144267144268144269144270144271144272144273144274144275144276144277144278144279144280144281144282144283144284144285144286144287144288144289144290144291144292144293144294144295144296144297144298144299144300144301144302144303144304144305144306144307144308144309144310144311144312144313144314144315144316144317144318144319144320144321144322144323144324144325144326144327144328144329144330144331144332144333144334144335144336144337144338144339144340144341144342144343144344144345144346144347144348144349144350144351144352144353144354144355144356144357144358144359144360144361144362144363144364144365144366144367144368144369144370144371144372144373144374144375144376144377144378144379144380144381144382144383144384144385144386144387144388144389144390144391144392144393144394144395144396144397144398144399144400144401144402144403144404144405144406144407144408144409144410144411144412144413144414144415144416144417144418144419144420144421144422144423144424144425144426144427144428144429144430144431144432144433144434144435144436144437144438144439144440144441144442144443144444144445144446144447144448144449144450144451144452144453144454144455144456144457144458144459144460144461144462144463144464144465144466144467144468144469144470144471144472144473144474144475144476144477144478144479144480144481144482144483144484144485144486144487144488144489144490144491144492144493144494144495144496144497144498144499144500144501144502144503144504144505144506144507144508144509144510144511144512144513144514144515144516144517144518144519144520144521144522144523144524144525144526144527144528144529144530144531144532144533144534144535144536144537144538144539144540144541144542144543144544144545144546144547144548144549144550144551144552144553144554144555144556144557144558144559144560144561144562144563144564144565144566144567144568144569144570144571144572144573144574144575144576144577144578144579144580144581144582144583144584144585144586144587144588144589144590144591144592144593144594144595144596144597144598144599144600144601144602144603144604144605144606144607144608144609144610144611144612144613144614144615144616144617144618144619144620144621144622144623144624144625144626144627144628144629144630144631144632144633144634144635144636144637144638144639144640144641144642144643144644144645144646144647144648144649144650144651144652144653144654144655144656144657144658144659144660144661144662144663144664144665144666144667144668144669144670144671144672144673144674144675144676144677144678144679144680144681144682144683144684144685144686144687144688144689144690144691144692144693144694144695144696144697144698144699144700144701144702144703144704144705144706144707144708144709144710144711144712144713144714144715144716144717144718144719144720144721144722144723144724144725144726144727144728144729144730144731144732144733144734144735144736144737144738144739144740144741144742144743144744144745144746144747144748144749144750144751144752144753144754144755144756144757144758144759144760144761144762144763144764144765144766144767144768144769144770144771144772144773144774144775144776144777144778144779144780144781144782144783144784144785144786144787144788144789144790144791144792144793144794144795144796144797144798144799144800144801144802144803144804144805144806144807144808144809144810144811144812144813144814144815144816144817144818144819144820144821144822144823144824144825144826144827144828144829144830144831144832144833144834144835144836144837144838144839144840144841144842144843144844144845144846144847144848144849144850144851144852144853144854144855144856144857144858144859144860144861144862144863144864144865144866144867144868144869144870144871144872144873144874144875144876144877144878144879144880144881144882144883144884144885144886144887144888144889144890144891144892144893144894144895144896144897144898144899144900144901144902144903144904144905144906144907144908144909144910144911144912144913144914144915144916144917144918144919144920144921144922144923144924144925144926144927144928144929144930144931144932144933144934144935144936144937144938144939144940144941144942144943144944144945144946144947144948144949144950144951144952144953144954144955144956144957144958144959144960144961144962144963144964144965144966144967144968144969144970144971144972144973144974144975144976144977144978144979144980144981144982144983144984144985144986144987144988144989144990144991144992144993144994144995144996144997144998144999145000145001145002145003145004145005145006145007145008145009145010145011145012145013145014145015145016145017145018145019145020145021145022145023145024145025145026145027145028145029145030145031145032145033145034145035145036145037145038145039145040145041145042145043145044145045145046145047145048145049145050145051145052145053145054145055145056145057145058145059145060145061145062145063145064145065145066145067145068145069145070145071145072145073145074145075145076145077145078145079145080145081145082145083145084145085145086145087145088145089145090145091145092145093145094145095145096145097145098145099145100145101145102145103145104145105145106145107145108145109145110145111145112145113145114145115145116145117145118145119145120145121145122145123145124145125145126145127145128145129145130145131145132145133145134145135145136145137145138145139145140145141145142145143145144145145145146145147145148145149145150145151145152145153145154145155145156145157145158145159145160145161145162145163145164145165145166145167145168145169145170145171145172145173145174145175145176145177145178145179145180145181145182145183145184145185145186145187145188145189145190145191145192145193145194145195145196145197145198145199145200145201145202145203145204145205145206145207145208145209145210145211145212145213145214145215145216145217145218145219145220145221145222145223145224145225145226145227145228145229145230145231145232145233145234145235145236145237145238145239145240145241145242145243145244145245145246145247145248145249145250145251145252145253145254145255145256145257145258145259145260145261145262145263145264145265145266145267145268145269145270145271145272145273145274145275145276145277145278145279145280145281145282145283145284145285145286145287145288145289145290145291145292145293145294145295145296145297145298145299145300145301145302145303145304145305145306145307145308145309145310145311145312145313145314145315145316145317145318145319145320145321145322145323145324145325145326145327145328145329145330145331145332145333145334145335145336145337145338145339145340145341145342145343145344145345145346145347145348145349145350145351145352145353145354145355145356145357145358145359145360145361145362145363145364145365145366145367145368145369145370145371145372145373145374145375145376145377145378145379145380145381145382145383145384145385145386145387145388145389145390145391145392145393145394145395145396145397145398145399145400145401145402145403145404145405145406145407145408145409145410145411145412145413145414145415145416145417145418145419145420145421145422145423145424145425145426145427145428145429145430145431145432145433145434145435145436145437145438145439145440145441145442145443145444145445145446145447145448145449145450145451145452145453145454145455145456145457145458145459145460145461145462145463145464145465145466145467145468145469145470145471145472145473145474145475145476145477145478145479145480145481145482145483145484145485145486145487145488145489145490145491145492145493145494145495145496145497145498145499145500145501145502145503145504145505145506145507145508145509145510145511145512145513145514145515145516145517145518145519145520145521145522145523145524145525145526145527145528145529145530145531145532145533145534145535145536145537145538145539145540145541145542145543145544145545145546145547145548145549145550145551145552145553145554145555145556145557145558145559145560145561145562145563145564145565145566145567145568145569145570145571145572145573145574145575145576145577145578145579145580145581145582145583145584145585145586145587145588145589145590145591145592145593145594145595145596145597145598145599145600145601145602145603145604145605145606145607145608145609145610145611145612145613145614145615145616145617145618145619145620145621145622145623145624145625145626145627145628145629145630145631145632145633145634145635145636145637145638145639145640145641145642145643145644145645145646145647145648145649145650145651145652145653145654145655145656145657145658145659145660145661145662145663145664145665145666145667145668145669145670145671145672145673145674145675145676145677145678145679145680145681145682145683145684145685145686145687145688145689145690145691145692145693145694145695145696145697145698145699145700145701145702145703145704145705145706145707145708145709145710145711145712145713145714145715145716145717145718145719145720145721145722145723145724145725145726145727145728145729145730145731145732145733145734145735145736145737145738145739145740145741145742145743145744145745145746145747145748145749145750145751145752145753145754145755145756145757145758145759145760145761145762145763145764145765145766145767145768145769145770145771145772145773145774145775145776145777145778145779145780145781145782145783145784145785145786145787145788145789145790145791145792145793145794145795145796145797145798145799145800145801145802145803145804145805145806145807145808145809145810145811145812145813145814145815145816145817145818145819145820145821145822145823145824145825145826145827145828145829145830145831145832145833145834145835145836145837145838145839145840145841145842145843145844145845145846145847145848145849145850145851145852145853145854145855145856145857145858145859145860145861145862145863145864145865145866145867145868145869145870145871145872145873145874145875145876145877145878145879145880145881145882145883145884145885145886145887145888145889145890145891145892145893145894145895145896145897145898145899145900145901145902145903145904145905145906145907145908145909145910145911145912145913145914145915145916145917145918145919145920145921145922145923145924145925145926145927145928145929145930145931145932145933145934145935145936145937145938145939145940145941145942145943145944145945145946145947145948145949145950145951145952145953145954145955145956145957145958145959145960145961145962145963145964145965145966145967145968145969145970145971145972145973145974145975145976145977145978145979145980145981145982145983145984145985145986145987145988145989145990145991145992145993145994145995145996145997145998145999146000146001146002146003146004146005146006146007146008146009146010146011146012146013146014146015146016146017146018146019146020146021146022146023146024146025146026146027146028146029146030146031146032146033146034146035146036146037146038146039146040146041146042146043146044146045146046146047146048146049146050146051146052146053146054146055146056146057146058146059146060146061146062146063146064146065146066146067146068146069146070146071146072146073146074146075146076146077146078146079146080146081146082146083146084146085146086146087146088146089146090146091146092146093146094146095146096146097146098146099146100146101146102146103146104146105146106146107146108146109146110146111146112146113146114146115146116146117146118146119146120146121146122146123146124146125146126146127146128146129146130146131146132146133146134146135146136146137146138146139146140146141146142146143146144146145146146146147146148146149146150146151146152146153146154146155146156146157146158146159146160146161146162146163146164146165146166146167146168146169146170146171146172146173146174146175146176146177146178146179146180146181146182146183146184146185146186146187146188146189146190146191146192146193146194146195146196146197146198146199146200146201146202146203146204146205146206146207146208146209146210146211146212146213146214146215146216146217146218146219146220146221146222146223146224146225146226146227146228146229146230146231146232146233146234146235146236146237146238146239146240146241146242146243146244146245146246146247146248146249146250146251146252146253146254146255146256146257146258146259146260146261146262146263146264146265146266146267146268146269146270146271146272146273146274146275146276146277146278146279146280146281146282146283146284146285146286146287146288146289146290146291146292146293146294146295146296146297146298146299146300146301146302146303146304146305146306146307146308146309146310146311146312146313146314146315146316146317146318146319146320146321146322146323146324146325146326146327146328146329146330146331146332146333146334146335146336146337146338146339146340146341146342146343146344146345146346146347146348146349146350146351146352146353146354146355146356146357146358146359146360146361146362146363146364146365146366146367146368146369146370146371146372146373146374146375146376146377146378146379146380146381146382146383146384146385146386146387146388146389146390146391146392146393146394146395146396146397146398146399146400146401146402146403146404146405146406146407146408146409146410146411146412146413146414146415146416146417146418146419146420146421146422146423146424146425146426146427146428146429146430146431146432146433146434146435146436146437146438146439146440146441146442146443146444146445146446146447146448146449146450146451146452146453146454146455146456146457146458146459146460146461146462146463146464146465146466146467146468146469146470146471146472146473146474146475146476146477146478146479146480146481146482146483146484146485146486146487146488146489146490146491146492146493146494146495146496146497146498146499146500146501146502146503146504146505146506146507146508146509146510146511146512146513146514146515146516146517146518146519146520146521146522146523146524146525146526146527146528146529146530146531146532146533146534146535146536146537146538146539146540146541146542146543146544146545146546146547146548146549146550146551146552146553146554146555146556146557146558146559146560146561146562146563146564146565146566146567146568146569146570146571146572146573146574146575146576146577146578146579146580146581146582146583146584146585146586146587146588146589146590146591146592146593146594146595146596146597146598146599146600146601146602146603146604146605146606146607146608146609146610146611146612146613146614146615146616146617146618146619146620146621146622146623146624146625146626146627146628146629146630146631146632146633146634146635146636146637146638146639146640146641146642146643146644146645146646146647146648146649146650146651146652146653146654146655146656146657146658146659146660146661146662146663146664146665146666146667146668146669146670146671146672146673146674146675146676146677146678146679146680146681146682146683146684146685146686146687146688146689146690146691146692146693146694146695146696146697146698146699146700146701146702146703146704146705146706146707146708146709146710146711146712146713146714146715146716146717146718146719146720146721146722146723146724146725146726146727146728146729146730146731146732146733146734146735146736146737146738146739146740146741146742146743146744146745146746146747146748146749146750146751146752146753146754146755146756146757146758146759146760146761146762146763146764146765146766146767146768146769146770146771146772146773146774146775146776146777146778146779146780146781146782146783146784146785146786146787146788146789146790146791146792146793146794146795146796146797146798146799146800146801146802146803146804146805146806146807146808146809146810146811146812146813146814146815146816146817146818146819146820146821146822146823146824146825146826146827146828146829146830146831146832146833146834146835146836146837146838146839146840146841146842146843146844146845146846146847146848146849146850146851146852146853146854146855146856146857146858146859146860146861146862146863146864146865146866146867146868146869146870146871146872146873146874146875146876146877146878146879146880146881146882146883146884146885146886146887146888146889146890146891146892146893146894146895146896146897146898146899146900146901146902146903146904146905146906146907146908146909146910146911146912146913146914146915146916146917146918146919146920146921146922146923146924146925146926146927146928146929146930146931146932146933146934146935146936146937146938146939146940146941146942146943146944146945146946146947146948146949146950146951146952146953146954146955146956146957146958146959146960146961146962146963146964146965146966146967146968146969146970146971146972146973146974146975146976146977146978146979146980146981146982146983146984146985146986146987146988146989146990146991146992146993146994146995146996146997146998146999147000147001147002147003147004147005147006147007147008147009147010147011147012147013147014147015147016147017147018147019147020147021147022147023147024147025147026147027147028147029147030147031147032147033147034147035147036147037147038147039147040147041147042147043147044147045147046147047147048147049147050147051147052147053147054147055147056147057147058147059147060147061147062147063147064147065147066147067147068147069147070147071147072147073147074147075147076147077147078147079147080147081147082147083147084147085147086147087147088147089147090147091147092147093147094147095147096147097147098147099147100147101147102147103147104147105147106147107147108147109147110147111147112147113147114147115147116147117147118147119147120147121147122147123147124147125147126147127147128147129147130147131147132147133147134147135147136147137147138147139147140147141147142147143147144147145147146147147147148147149147150147151147152147153147154147155147156147157147158147159147160147161147162147163147164147165147166147167147168147169147170147171147172147173147174147175147176147177147178147179147180147181147182147183147184147185147186147187147188147189147190147191147192147193147194147195147196147197147198147199147200147201147202147203147204147205147206147207147208147209147210147211147212147213147214147215147216147217147218147219147220147221147222147223147224147225147226147227147228147229147230147231147232147233147234147235147236147237147238147239147240147241147242147243147244147245147246147247147248147249147250147251147252147253147254147255147256147257147258147259147260147261147262147263147264147265147266147267147268147269147270147271147272147273147274147275147276147277147278147279147280147281147282147283147284147285147286147287147288147289147290147291147292147293147294147295147296147297147298147299147300147301147302147303147304147305147306147307147308147309147310147311147312147313147314147315147316147317147318147319147320147321147322147323147324147325147326147327147328147329147330147331147332147333147334147335147336147337147338147339147340147341147342147343147344147345147346147347147348147349147350147351147352147353147354147355147356147357147358147359147360147361147362147363147364147365147366147367147368147369147370147371147372147373147374147375147376147377147378147379147380147381147382147383147384147385147386147387147388147389147390147391147392147393147394147395147396147397147398147399147400147401147402147403147404147405147406147407147408147409147410147411147412147413147414147415147416147417147418147419147420147421147422147423147424147425147426147427147428147429147430147431147432147433147434147435147436147437147438147439147440147441147442147443147444147445147446147447147448147449147450147451147452147453147454147455147456147457147458147459147460147461147462147463147464147465147466147467147468147469147470147471147472147473147474147475147476147477147478147479147480147481147482147483147484147485147486147487147488147489147490147491147492147493147494147495147496147497147498147499147500147501147502147503147504147505147506147507147508147509147510147511147512147513147514147515147516147517147518147519147520147521147522147523147524147525147526147527147528147529147530147531147532147533147534147535147536147537147538147539147540147541147542147543147544147545147546147547147548147549147550147551147552147553147554147555147556147557147558147559147560147561147562147563147564147565147566147567147568147569147570147571147572147573147574147575147576147577147578147579147580147581147582147583147584147585147586147587147588147589147590147591147592147593147594147595147596147597147598147599147600147601147602147603147604147605147606147607147608147609147610147611147612147613147614147615147616147617147618147619147620147621147622147623147624147625147626147627147628147629147630147631147632147633147634147635147636147637147638147639147640147641147642147643147644147645147646147647147648147649147650147651147652147653147654147655147656147657147658147659147660147661147662147663147664147665147666147667147668147669147670147671147672147673147674147675147676147677147678147679147680147681147682147683147684147685147686147687147688147689147690147691147692147693147694147695147696147697147698147699147700147701147702147703147704147705147706147707147708147709147710147711147712147713147714147715147716147717147718147719147720147721147722147723147724147725147726147727147728147729147730147731147732147733147734147735147736147737147738147739147740147741147742147743147744147745147746147747147748147749147750147751147752147753147754147755147756147757147758147759147760147761147762147763147764147765147766147767147768147769147770147771147772147773147774147775147776147777147778147779147780147781147782147783147784147785147786147787147788147789147790147791147792147793147794147795147796147797147798147799147800147801147802147803147804147805147806147807147808147809147810147811147812147813147814147815147816147817147818147819147820147821147822147823147824147825147826147827147828147829147830147831147832147833147834147835147836147837147838147839147840147841147842147843147844147845147846147847147848147849147850147851147852147853147854147855147856147857147858147859147860147861147862147863147864147865147866147867147868147869147870147871147872147873147874147875147876147877147878147879147880147881147882147883147884147885147886147887147888147889147890147891147892147893147894147895147896147897147898147899147900147901147902147903147904147905147906147907147908147909147910147911147912147913147914147915147916147917147918147919147920147921147922147923147924147925147926147927147928147929147930147931147932147933147934147935147936147937147938147939147940147941147942147943147944147945147946147947147948147949147950147951147952147953147954147955147956147957147958147959147960147961147962147963147964147965147966147967147968147969147970147971147972147973147974147975147976147977147978147979147980147981147982147983147984147985147986147987147988147989147990147991147992147993147994147995147996147997147998147999148000148001148002148003148004148005148006148007148008148009148010148011148012148013148014148015148016148017148018148019148020148021148022148023148024148025148026148027148028148029148030148031148032148033148034148035148036148037148038148039148040148041148042148043148044148045148046148047148048148049148050148051148052148053148054148055148056148057148058148059148060148061148062148063148064148065148066148067148068148069148070148071148072148073148074148075148076148077148078148079148080148081148082148083148084148085148086148087148088148089148090148091148092148093148094148095148096148097148098148099148100148101148102148103148104148105148106148107148108148109148110148111148112148113148114148115148116148117148118148119148120148121148122148123148124148125148126148127148128148129148130148131148132148133148134148135148136148137148138148139148140148141148142148143148144148145148146148147148148148149148150148151148152148153148154148155148156148157148158148159148160148161148162148163148164148165148166148167148168148169148170148171148172148173148174148175148176148177148178148179148180148181148182148183148184148185148186148187148188148189148190148191148192148193148194148195148196148197148198148199148200148201148202148203148204148205148206148207148208148209148210148211148212148213148214148215148216148217148218148219148220148221148222148223148224148225148226148227148228148229148230148231148232148233148234148235148236148237148238148239148240148241148242148243148244148245148246148247148248148249148250148251148252148253148254148255148256148257148258148259148260148261148262148263148264148265148266148267148268148269148270148271148272148273148274148275148276148277148278148279148280148281148282148283148284148285148286148287148288148289148290148291148292148293148294148295148296148297148298148299148300148301148302148303148304148305148306148307148308148309148310148311148312148313148314148315148316148317148318148319148320148321148322148323148324148325148326148327148328148329148330148331148332148333148334148335148336148337148338148339148340148341148342148343148344148345148346148347148348148349148350148351148352148353148354148355148356148357148358148359148360148361148362148363148364148365148366148367148368148369148370148371148372148373148374148375148376148377148378148379148380148381148382148383148384148385148386148387148388148389148390148391148392148393148394148395148396148397148398148399148400148401148402148403148404148405148406148407148408148409148410148411148412148413148414148415148416148417148418148419148420148421148422148423148424148425148426148427148428148429148430148431148432148433148434148435148436148437148438148439148440148441148442148443148444148445148446148447148448148449148450148451148452148453148454148455148456148457148458148459148460148461148462148463148464148465148466148467148468148469148470148471148472148473148474148475148476148477148478148479148480148481148482148483148484148485148486148487148488148489148490148491148492148493148494148495148496148497148498148499148500148501148502148503148504148505148506148507148508148509148510148511148512148513148514148515148516148517148518148519148520148521148522148523148524148525148526148527148528148529148530148531148532148533148534148535148536148537148538148539148540148541148542148543148544148545148546148547148548148549148550148551148552148553148554148555148556148557148558148559148560148561148562148563148564148565148566148567148568148569148570148571148572148573148574148575148576148577148578148579148580148581148582148583148584148585148586148587148588148589148590148591148592148593148594148595148596148597148598148599148600148601148602148603148604148605148606148607148608148609148610148611148612148613148614148615148616148617148618148619148620148621148622148623148624148625148626148627148628148629148630148631148632148633148634148635148636148637148638148639148640148641148642148643148644148645148646148647148648148649148650148651148652148653148654148655148656148657148658148659148660148661148662148663148664148665148666148667148668148669148670148671148672148673148674148675148676148677148678148679148680148681148682148683148684148685148686148687148688148689148690148691148692148693148694148695148696148697148698148699148700148701148702148703148704148705148706148707148708148709148710148711148712148713148714148715148716148717148718148719148720148721148722148723148724148725148726148727148728148729148730148731148732148733148734148735148736148737148738148739148740148741148742148743148744148745148746148747148748148749148750148751148752148753148754148755148756148757148758148759148760148761148762148763148764148765148766148767148768148769148770148771148772148773148774148775148776148777148778148779148780148781148782148783148784148785148786148787148788148789148790148791148792148793148794148795148796148797148798148799148800148801148802148803148804148805148806148807148808148809148810148811148812148813148814148815148816148817148818148819148820148821148822148823148824148825148826148827148828148829148830148831148832148833148834148835148836148837148838148839148840148841148842148843148844148845148846148847148848148849148850148851148852148853148854148855148856148857148858148859148860148861148862148863148864148865148866148867148868148869148870148871148872148873148874148875148876148877148878148879148880148881148882148883148884148885148886148887148888148889148890148891148892148893148894148895148896148897148898148899148900148901148902148903148904148905148906148907148908148909148910148911148912148913148914148915148916148917148918148919148920148921148922148923148924148925148926148927148928148929148930148931148932148933148934148935148936148937148938148939148940148941148942148943148944148945148946148947148948148949148950148951148952148953148954148955148956148957148958148959148960148961148962148963148964148965148966148967148968148969148970148971148972148973148974148975148976148977148978148979148980148981148982148983148984148985148986148987148988148989148990148991148992148993148994148995148996148997148998148999149000149001149002149003149004149005149006149007149008149009149010149011149012149013149014149015149016149017149018149019149020149021149022149023149024149025149026149027149028149029149030149031149032149033149034149035149036149037149038149039149040149041149042149043149044149045149046149047149048149049149050149051149052149053149054149055149056149057149058149059149060149061149062149063149064149065149066149067149068149069149070149071149072149073149074149075149076149077149078149079149080149081149082149083149084149085149086149087149088149089149090149091149092149093149094149095149096149097149098149099149100149101149102149103149104149105149106149107149108149109149110149111149112149113149114149115149116149117149118149119149120149121149122149123149124149125149126149127149128149129149130149131149132149133149134149135149136149137149138149139149140149141149142149143149144149145149146149147149148149149149150149151149152149153149154149155149156149157149158149159149160149161149162149163149164149165149166149167149168149169149170149171149172149173149174149175149176149177149178149179149180149181149182149183149184149185149186149187149188149189149190149191149192149193149194149195149196149197149198149199149200149201149202149203149204149205149206149207149208149209149210149211149212149213149214149215149216149217149218149219149220149221149222149223149224149225149226149227149228149229149230149231149232149233149234149235149236149237149238149239149240149241149242149243149244149245149246149247149248149249149250149251149252149253149254149255149256149257149258149259149260149261149262149263149264149265149266149267149268149269149270149271149272149273149274149275149276149277149278149279149280149281149282149283149284149285149286149287149288149289149290149291149292149293149294149295149296149297149298149299149300149301149302149303149304149305149306149307149308149309149310149311149312149313149314149315149316149317149318149319149320149321149322149323149324149325149326149327149328149329149330149331149332149333149334149335149336149337149338149339149340149341149342149343149344149345149346149347149348149349149350149351149352149353149354149355149356149357149358149359149360149361149362149363149364149365149366149367149368149369149370149371149372149373149374149375149376149377149378149379149380149381149382149383149384149385149386149387149388149389149390149391149392149393149394149395149396149397149398149399149400149401149402149403149404149405149406149407149408149409149410149411149412149413149414149415149416149417149418149419149420149421149422149423149424149425149426149427149428149429149430149431149432149433149434149435149436149437149438149439149440149441149442149443149444149445149446149447149448149449149450149451149452149453149454149455149456149457149458149459149460149461149462149463149464149465149466149467149468149469149470149471149472149473149474149475149476149477149478149479149480149481149482149483149484149485149486149487149488149489149490149491149492149493149494149495149496149497149498149499149500149501149502149503149504149505149506149507149508149509149510149511149512149513149514149515149516149517149518149519149520149521149522149523149524149525149526149527149528149529149530149531149532149533149534149535149536149537149538149539149540149541149542149543149544149545149546149547149548149549149550149551149552149553149554149555149556149557149558149559149560149561149562149563149564149565149566149567149568149569149570149571149572149573149574149575149576149577149578149579149580149581149582149583149584149585149586149587149588149589149590149591149592149593149594149595149596149597149598149599149600149601149602149603149604149605149606149607149608149609149610149611149612149613149614149615149616149617149618149619149620149621149622149623149624149625149626149627149628149629149630149631149632149633149634149635149636149637149638149639149640149641149642149643149644149645149646149647149648149649149650149651149652149653149654149655149656149657149658149659149660149661149662149663149664149665149666149667149668149669149670149671149672149673149674149675149676149677149678149679149680149681149682149683149684149685149686149687149688149689149690149691149692149693149694149695149696149697149698149699149700149701149702149703149704149705149706149707149708149709149710149711149712149713149714149715149716149717149718149719149720149721149722149723149724149725149726149727149728149729149730149731149732149733149734149735149736149737149738149739149740149741149742149743149744149745149746149747149748149749149750149751149752149753149754149755149756149757149758149759149760149761149762149763149764149765149766149767149768149769149770149771149772149773149774149775149776149777149778149779149780149781149782149783149784149785149786149787149788149789149790149791149792149793149794149795149796149797149798149799149800149801149802149803149804149805149806149807149808149809149810149811149812149813149814149815149816149817149818149819149820149821149822149823149824149825149826149827149828149829149830149831149832149833149834149835149836149837149838149839149840149841149842149843149844149845149846149847149848149849149850149851149852149853149854149855149856149857149858149859149860149861149862149863149864149865149866149867149868149869149870149871149872149873149874149875149876149877149878149879149880149881149882149883149884149885149886149887149888149889149890149891149892149893149894149895149896149897149898149899149900149901149902149903149904149905149906149907149908149909149910149911149912149913149914149915149916149917149918149919149920149921149922149923149924149925149926149927149928149929149930149931149932149933149934149935149936149937149938149939149940149941149942149943149944149945149946149947149948149949149950149951149952149953149954149955149956149957149958149959149960149961149962149963149964149965149966149967149968149969149970149971149972149973149974149975149976149977149978149979149980149981149982149983149984149985149986149987149988149989149990149991149992149993149994149995149996149997149998149999150000150001150002150003150004150005150006150007150008150009150010150011150012150013150014150015150016150017150018150019150020150021150022150023150024150025150026150027150028150029150030150031150032150033150034150035150036150037150038150039150040150041150042150043150044150045150046150047150048150049150050150051150052150053150054150055150056150057150058150059150060150061150062150063150064150065150066150067150068150069150070150071150072150073150074150075150076150077150078150079150080150081150082150083150084150085150086150087150088150089150090150091150092150093150094150095150096150097150098150099150100150101150102150103150104150105150106150107150108150109150110150111150112150113150114150115150116150117150118150119150120150121150122150123150124150125150126150127150128150129150130150131150132150133150134150135150136150137150138150139150140150141150142150143150144150145150146150147150148150149150150150151150152150153150154150155150156150157150158150159150160150161150162150163150164150165150166150167150168150169150170150171150172150173150174150175150176150177150178150179150180150181150182150183150184150185150186150187150188150189150190150191150192150193150194150195150196150197150198150199150200150201150202150203150204150205150206150207150208150209150210150211150212150213150214150215150216150217150218150219150220150221150222150223150224150225150226150227150228150229150230150231150232150233150234150235150236150237150238150239150240150241150242150243150244150245150246150247150248150249150250150251150252150253150254150255150256150257150258150259150260150261150262150263150264150265150266150267150268150269150270150271150272150273150274150275150276150277150278150279150280150281150282150283150284150285150286150287150288150289150290150291150292150293150294150295150296150297150298150299150300150301150302150303150304150305150306150307150308150309150310150311150312150313150314150315150316150317150318150319150320150321150322150323150324150325150326150327150328150329150330150331150332150333150334150335150336150337150338150339150340150341150342150343150344150345150346150347150348150349150350150351150352150353150354150355150356150357150358150359150360150361150362150363150364150365150366150367150368150369150370150371150372150373150374150375150376150377150378150379150380150381150382150383150384150385150386150387150388150389150390150391150392150393150394150395150396150397150398150399150400150401150402150403150404150405150406150407150408150409150410150411150412150413150414150415150416150417150418150419150420150421150422150423150424150425150426150427150428150429150430150431150432150433150434150435150436150437150438150439150440150441150442150443150444150445150446150447150448150449150450150451150452150453150454150455150456150457150458150459150460150461150462150463150464150465150466150467150468150469150470150471150472150473150474150475150476150477150478150479150480150481150482150483150484150485150486150487150488150489150490150491150492150493150494150495150496150497150498150499150500150501150502150503150504150505150506150507150508150509150510150511150512150513150514150515150516150517150518150519150520150521150522150523150524150525150526150527150528150529150530150531150532150533150534150535150536150537150538150539150540150541150542150543150544150545150546150547150548150549150550150551150552150553150554150555150556150557150558150559150560150561150562150563150564150565150566150567150568150569150570150571150572150573150574150575150576150577150578150579150580150581150582150583150584150585150586150587150588150589150590150591150592150593150594150595150596150597150598150599150600150601150602150603150604150605150606150607150608150609150610150611150612150613150614150615150616150617150618150619150620150621150622150623150624150625150626150627150628150629150630150631150632150633150634150635150636150637150638150639150640150641150642150643150644150645150646150647150648150649150650150651150652150653150654150655150656150657150658150659150660150661150662150663150664150665150666150667150668150669150670150671150672150673150674150675150676150677150678150679150680150681150682150683150684150685150686150687150688150689150690150691150692150693150694150695150696150697150698150699150700150701150702150703150704150705150706150707150708150709150710150711150712150713150714150715150716150717150718150719150720150721150722150723150724150725150726150727150728150729150730150731150732150733150734150735150736150737150738150739150740150741150742150743150744150745150746150747150748150749150750150751150752150753150754150755150756150757150758150759150760150761150762150763150764150765150766150767150768150769150770150771150772150773150774150775150776150777150778150779150780150781150782150783150784150785150786150787150788150789150790150791150792150793150794150795150796150797150798150799150800150801150802150803150804150805150806150807150808150809150810150811150812150813150814150815150816150817150818150819150820150821150822150823150824150825150826150827150828150829150830150831150832150833150834150835150836150837150838150839150840150841150842150843150844150845150846150847150848150849150850150851150852150853150854150855150856150857150858150859150860150861150862150863150864150865150866150867150868150869150870150871150872150873150874150875150876150877150878150879150880150881150882150883150884150885150886150887150888150889150890150891150892150893150894150895150896150897150898150899150900150901150902150903150904150905150906150907150908150909150910150911150912150913150914150915150916150917150918150919150920150921150922150923150924150925150926150927150928150929150930150931150932150933150934150935150936150937150938150939150940150941150942150943150944150945150946150947150948150949150950150951150952150953150954150955150956150957150958150959150960150961150962150963150964150965150966150967150968150969150970150971150972150973150974150975150976150977150978150979150980150981150982150983150984150985150986150987150988150989150990150991150992150993150994150995150996150997150998150999151000151001151002151003151004151005151006151007151008151009151010151011151012151013151014151015151016151017151018151019151020151021151022151023151024151025151026151027151028151029151030151031151032151033151034151035151036151037151038151039151040151041151042151043151044151045151046151047151048151049151050151051151052151053151054151055151056151057151058151059151060151061151062151063151064151065151066151067151068151069151070151071151072151073151074151075151076151077151078151079151080151081151082151083151084151085151086151087151088151089151090151091151092151093151094151095151096151097151098151099151100151101151102151103151104151105151106151107151108151109151110151111151112151113151114151115151116151117151118151119151120151121151122151123151124151125151126151127151128151129151130151131151132151133151134151135151136151137151138151139151140151141151142151143151144151145151146151147151148151149151150151151151152151153151154151155151156151157151158151159151160151161151162151163151164151165151166151167151168151169151170151171151172151173151174151175151176151177151178151179151180151181151182151183151184151185151186151187151188151189151190151191151192151193151194151195151196151197151198151199151200151201151202151203151204151205151206151207151208151209151210151211151212151213151214151215151216151217151218151219151220151221151222151223151224151225151226151227151228151229151230151231151232151233151234151235151236151237151238151239151240151241151242151243151244151245151246151247151248151249151250151251151252151253151254151255151256151257151258151259151260151261151262151263151264151265151266151267151268151269151270151271151272151273151274151275151276151277151278151279151280151281151282151283151284151285151286151287151288151289151290151291151292151293151294151295151296151297151298151299151300151301151302151303151304151305151306151307151308151309151310151311151312151313151314151315151316151317151318151319151320151321151322151323151324151325151326151327151328151329151330151331151332151333151334151335151336151337151338151339151340151341151342151343151344151345151346151347151348151349151350151351151352151353151354151355151356151357151358151359151360151361151362151363151364151365151366151367151368151369151370151371151372151373151374151375151376151377151378151379151380151381151382151383151384151385151386151387151388151389151390151391151392151393151394151395151396151397151398151399151400151401151402151403151404151405151406151407151408151409151410151411151412151413151414151415151416151417151418151419151420151421151422151423151424151425151426151427151428151429151430151431151432151433151434151435151436151437151438151439151440151441151442151443151444151445151446151447151448151449151450151451151452151453151454151455151456151457151458151459151460151461151462151463151464151465151466151467151468151469151470151471151472151473151474151475151476151477151478151479151480151481151482151483151484151485151486151487151488151489151490151491151492151493151494151495151496151497151498151499151500151501151502151503151504151505151506151507151508151509151510151511151512151513151514151515151516151517151518151519151520151521151522151523151524151525151526151527151528151529151530151531151532151533151534151535151536151537151538151539151540151541151542151543151544151545151546151547151548151549151550151551151552151553151554151555151556151557151558151559151560151561151562151563151564151565151566151567151568151569151570151571151572151573151574151575151576151577151578151579151580151581151582151583151584151585151586151587151588151589151590151591151592151593151594151595151596151597151598151599151600151601151602151603151604151605151606151607151608151609151610151611151612151613151614151615151616151617151618151619151620151621151622151623151624151625151626151627151628151629151630151631151632151633151634151635151636151637151638151639151640151641151642151643151644151645151646151647151648151649151650151651151652151653151654151655151656151657151658151659151660151661151662151663151664151665151666151667151668151669151670151671151672151673151674151675151676151677151678151679151680151681151682151683151684151685151686151687151688151689151690151691151692151693151694151695151696151697151698151699151700151701151702151703151704151705151706151707151708151709151710151711151712151713151714151715151716151717151718151719151720151721151722151723151724151725151726151727151728151729151730151731151732151733151734151735151736151737151738151739151740151741151742151743151744151745151746151747151748151749151750151751151752151753151754151755151756151757151758151759151760151761151762151763151764151765151766151767151768151769151770151771151772151773151774151775151776151777151778151779151780151781151782151783151784151785151786151787151788151789151790151791151792151793151794151795151796151797151798151799151800151801151802151803151804151805151806151807151808151809151810151811151812151813151814151815151816151817151818151819151820151821151822151823151824151825151826151827151828151829151830151831151832151833151834151835151836151837151838151839151840151841151842151843151844151845151846151847151848151849151850151851151852151853151854151855151856151857151858151859151860151861151862151863151864151865151866151867151868151869151870151871151872151873151874151875151876151877151878151879151880151881151882151883151884151885151886151887151888151889151890151891151892151893151894151895151896151897151898151899151900151901151902151903151904151905151906151907151908151909151910151911151912151913151914151915151916151917151918151919151920151921151922151923151924151925151926151927151928151929151930151931151932151933151934151935151936151937151938151939151940151941151942151943151944151945151946151947151948151949151950151951151952151953151954151955151956151957151958151959151960151961151962151963151964151965151966151967151968151969151970151971151972151973151974151975151976151977151978151979151980151981151982151983151984151985151986151987151988151989151990151991151992151993151994151995151996151997151998151999152000152001152002152003152004152005152006152007152008152009152010152011152012152013152014152015152016152017152018152019152020152021152022152023152024152025152026152027152028152029152030152031152032152033152034152035152036152037152038152039152040152041152042152043152044152045152046152047152048152049152050152051152052152053152054152055152056152057152058152059152060152061152062152063152064152065152066152067152068152069152070152071152072152073152074152075152076152077152078152079152080152081152082152083152084152085152086152087152088152089152090152091152092152093152094152095152096152097152098152099152100152101152102152103152104152105152106152107152108152109152110152111152112152113152114152115152116152117152118152119152120152121152122152123152124152125152126152127152128152129152130152131152132152133152134152135152136152137152138152139152140152141152142152143152144152145152146152147152148152149152150152151152152152153152154152155152156152157152158152159152160152161152162152163152164152165152166152167152168152169152170152171152172152173152174152175152176152177152178152179152180152181152182152183152184152185152186152187152188152189152190152191152192152193152194152195152196152197152198152199152200152201152202152203152204152205152206152207152208152209152210152211152212152213152214152215152216152217152218152219152220152221152222152223152224152225152226152227152228152229152230152231152232152233152234152235152236152237152238152239152240152241152242152243152244152245152246152247152248152249152250152251152252152253152254152255152256152257152258152259152260152261152262152263152264152265152266152267152268152269152270152271152272152273152274152275152276152277152278152279152280152281152282152283152284152285152286152287152288152289152290152291152292152293152294152295152296152297152298152299152300152301152302152303152304152305152306152307152308152309152310152311152312152313152314152315152316152317152318152319152320152321152322152323152324152325152326152327152328152329152330152331152332152333152334152335152336152337152338152339152340152341152342152343152344152345152346152347152348152349152350152351152352152353152354152355152356152357152358152359152360152361152362152363152364152365152366152367152368152369152370152371152372152373152374152375152376152377152378152379152380152381152382152383152384152385152386152387152388152389152390152391152392152393152394152395152396152397152398152399152400152401152402152403152404152405152406152407152408152409152410152411152412152413152414152415152416152417152418152419152420152421152422152423152424152425152426152427152428152429152430152431152432152433152434152435152436152437152438152439152440152441152442152443152444152445152446152447152448152449152450152451152452152453152454152455152456152457152458152459152460152461152462152463152464152465152466152467152468152469152470152471152472152473152474152475152476152477152478152479152480152481152482152483152484152485152486152487152488152489152490152491152492152493152494152495152496152497152498152499152500152501152502152503152504152505152506152507152508152509152510152511152512152513152514152515152516152517152518152519152520152521152522152523152524152525152526152527152528152529152530152531152532152533152534152535152536152537152538152539152540152541152542152543152544152545152546152547152548152549152550152551152552152553152554152555152556152557152558152559152560152561152562152563152564152565152566152567152568152569152570152571152572152573152574152575152576152577152578152579152580152581152582152583152584152585152586152587152588152589152590152591152592152593152594152595152596152597152598152599152600152601152602152603152604152605152606152607152608152609152610152611152612152613152614152615152616152617152618152619152620152621152622152623152624152625152626152627152628152629152630152631152632152633152634152635152636152637152638152639152640152641152642152643152644152645152646152647152648152649152650152651152652152653152654152655152656152657152658152659152660152661152662152663152664152665152666152667152668152669152670152671152672152673152674152675152676152677152678152679152680152681152682152683152684152685152686152687152688152689152690152691152692152693152694152695152696152697152698152699152700152701152702152703152704152705152706152707152708152709152710152711152712152713152714152715152716152717152718152719152720152721152722152723152724152725152726152727152728152729152730152731152732152733152734152735152736152737152738152739152740152741152742152743152744152745152746152747152748152749152750152751152752152753152754152755152756152757152758152759152760152761152762152763152764152765152766152767152768152769152770152771152772152773152774152775152776152777152778152779152780152781152782152783152784152785152786152787152788152789152790152791152792152793152794152795152796152797152798152799152800152801152802152803152804152805152806152807152808152809152810152811152812152813152814152815152816152817152818152819152820152821152822152823152824152825152826152827152828152829152830152831152832152833152834152835152836152837152838152839152840152841152842152843152844152845152846152847152848152849152850152851152852152853152854152855152856152857152858152859152860152861152862152863152864152865152866152867152868152869152870152871152872152873152874152875152876152877152878152879152880152881152882152883152884152885152886152887152888152889152890152891152892152893152894152895152896152897152898152899152900152901152902152903152904152905152906152907152908152909152910152911152912152913152914152915152916152917152918152919152920152921152922152923152924152925152926152927152928152929152930152931152932152933152934152935152936152937152938152939152940152941152942152943152944152945152946152947152948152949152950152951152952152953152954152955152956152957152958152959152960152961152962152963152964152965152966152967152968152969152970152971152972152973152974152975152976152977152978152979152980152981152982152983152984152985152986152987152988152989152990152991152992152993152994152995152996152997152998152999153000153001153002153003153004153005153006153007153008153009153010153011153012153013153014153015153016153017153018153019153020153021153022153023153024153025153026153027153028153029153030153031153032153033153034153035153036153037153038153039153040153041153042153043153044153045153046153047153048153049153050153051153052153053153054153055153056153057153058153059153060153061153062153063153064153065153066153067153068153069153070153071153072153073153074153075153076153077153078153079153080153081153082153083153084153085153086153087153088153089153090153091153092153093153094153095153096153097153098153099153100153101153102153103153104153105153106153107153108153109153110153111153112153113153114153115153116153117153118153119153120153121153122153123153124153125153126153127153128153129153130153131153132153133153134153135153136153137153138153139153140153141153142153143153144153145153146153147153148153149153150153151153152153153153154153155153156153157153158153159153160153161153162153163153164153165153166153167153168153169153170153171153172153173153174153175153176153177153178153179153180153181153182153183153184153185153186153187153188153189153190153191153192153193153194153195153196153197153198153199153200153201153202153203153204153205153206153207153208153209153210153211153212153213153214153215153216153217153218153219153220153221153222153223153224153225153226153227153228153229153230153231153232153233153234153235153236153237153238153239153240153241153242153243153244153245153246153247153248153249153250153251153252153253153254153255153256153257153258153259153260153261153262153263153264153265153266153267153268153269153270153271153272153273153274153275153276153277153278153279153280153281153282153283153284153285153286153287153288153289153290153291153292153293153294153295153296153297153298153299153300153301153302153303153304153305153306153307153308153309153310153311153312153313153314153315153316153317153318153319153320153321153322153323153324153325153326153327153328153329153330153331153332153333153334153335153336153337153338153339153340153341153342153343153344153345153346153347153348153349153350153351153352153353153354153355153356153357153358153359153360153361153362153363153364153365153366153367153368153369153370153371153372153373153374153375153376153377153378153379153380153381153382153383153384153385153386153387153388153389153390153391153392153393153394153395153396153397153398153399153400153401153402153403153404153405153406153407153408153409153410153411153412153413153414153415153416153417153418153419153420153421153422153423153424153425153426153427153428153429153430153431153432153433153434153435153436153437153438153439153440153441153442153443153444153445153446153447153448153449153450153451153452153453153454153455153456153457153458153459153460153461153462153463153464153465153466153467153468153469153470153471153472153473153474153475153476153477153478153479153480153481153482153483153484153485153486153487153488153489153490153491153492153493153494153495153496153497153498153499153500153501153502153503153504153505153506153507153508153509153510153511153512153513153514153515153516153517153518153519153520153521153522153523153524153525153526153527153528153529153530153531153532153533153534153535153536153537153538153539153540153541153542153543153544153545153546153547153548153549153550153551153552153553153554153555153556153557153558153559153560153561153562153563153564153565153566153567153568153569153570153571153572153573153574153575153576153577153578153579153580153581153582153583153584153585153586153587153588153589153590153591153592153593153594153595153596153597153598153599153600153601153602153603153604153605153606153607153608153609153610153611153612153613153614153615153616153617153618153619153620153621153622153623153624153625153626153627153628153629153630153631153632153633153634153635153636153637153638153639153640153641153642153643153644153645153646153647153648153649153650153651153652153653153654153655153656153657153658153659153660153661153662153663153664153665153666153667153668153669153670153671153672153673153674153675153676153677153678153679153680153681153682153683153684153685153686153687153688153689153690153691153692153693153694153695153696153697153698153699153700153701153702153703153704153705153706153707153708153709153710153711153712153713153714153715153716153717153718153719153720153721153722153723153724153725153726153727153728153729153730153731153732153733153734153735153736153737153738153739153740153741153742153743153744153745153746153747153748153749153750153751153752153753153754153755153756153757153758153759153760153761153762153763153764153765153766153767153768153769153770153771153772153773153774153775153776153777153778153779153780153781153782153783153784153785153786153787153788153789153790153791153792153793153794153795153796153797153798153799153800153801153802153803153804153805153806153807153808153809153810153811153812153813153814153815153816153817153818153819153820153821153822153823153824153825153826153827153828153829153830153831153832153833153834153835153836153837153838153839153840153841153842153843153844153845153846153847153848153849153850153851153852153853153854153855153856153857153858153859153860153861153862153863153864153865153866153867153868153869153870153871153872153873153874153875153876153877153878153879153880153881153882153883153884153885153886153887153888153889153890153891153892153893153894153895153896153897153898153899153900153901153902153903153904153905153906153907153908153909153910153911153912153913153914153915153916153917153918153919153920153921153922153923153924153925153926153927153928153929153930153931153932153933153934153935153936153937153938153939153940153941153942153943153944153945153946153947153948153949153950153951153952153953153954153955153956153957153958153959153960153961153962153963153964153965153966153967153968153969153970153971153972153973153974153975153976153977153978153979153980153981153982153983153984153985153986153987153988153989153990153991153992153993153994153995153996153997153998153999154000154001154002154003154004154005154006154007154008154009154010154011154012154013154014154015154016154017154018154019154020154021154022154023154024154025154026154027154028154029154030154031154032154033154034154035154036154037154038154039154040154041154042154043154044154045154046154047154048154049154050154051154052154053154054154055154056154057154058154059154060154061154062154063154064154065154066154067154068154069154070154071154072154073154074154075154076154077154078154079154080154081154082154083154084154085154086154087154088154089154090154091154092154093154094154095154096154097154098154099154100154101154102154103154104154105154106154107154108154109154110154111154112154113154114154115154116154117154118154119154120154121154122154123154124154125154126154127154128154129154130154131154132154133154134154135154136154137154138154139154140154141154142154143154144154145154146154147154148154149154150154151154152154153154154154155154156154157154158154159154160154161154162154163154164154165154166154167154168154169154170154171154172154173154174154175154176154177154178154179154180154181154182154183154184154185154186154187154188154189154190154191154192154193154194154195154196154197154198154199154200154201154202154203154204154205154206154207154208154209154210154211154212154213154214154215154216154217154218154219154220154221154222154223154224154225154226154227154228154229154230154231154232154233154234154235154236154237154238154239154240154241154242154243154244154245154246154247154248154249154250154251154252154253154254154255154256154257154258154259154260154261154262154263154264154265154266154267154268154269154270154271154272154273154274154275154276154277154278154279154280154281154282154283154284154285154286154287154288154289154290154291154292154293154294154295154296154297154298154299154300154301154302154303154304154305154306154307154308154309154310154311154312154313154314154315154316154317154318154319154320154321154322154323154324154325154326154327154328154329154330154331154332154333154334154335154336154337154338154339154340154341154342154343154344154345154346154347154348154349154350154351154352154353154354154355154356154357154358154359154360154361154362154363154364154365154366154367154368154369154370154371154372154373154374154375154376154377154378154379154380154381154382154383154384154385154386154387154388154389154390154391154392154393154394154395154396154397154398154399154400154401154402154403154404154405154406154407154408154409154410154411154412154413154414154415154416154417154418154419154420154421154422154423154424154425154426154427154428154429154430154431154432154433154434154435154436154437154438154439154440154441154442154443154444154445154446154447154448154449154450154451154452154453154454154455154456154457154458154459154460154461154462154463154464154465154466154467154468154469154470154471154472154473154474154475154476154477154478154479154480154481154482154483154484154485154486154487154488154489154490154491154492154493154494154495154496154497154498154499154500154501154502154503154504154505154506154507154508154509154510154511154512154513154514154515154516154517154518154519154520154521154522154523154524154525154526154527154528154529154530154531154532154533154534154535154536154537154538154539154540154541154542154543154544154545154546154547154548154549154550154551154552154553154554154555154556154557154558154559154560154561154562154563154564154565154566154567154568154569154570154571154572154573154574154575154576154577154578154579154580154581154582154583154584154585154586154587154588154589154590154591154592154593154594154595154596154597154598154599154600154601154602154603154604154605154606154607154608154609154610154611154612154613154614154615154616154617154618154619154620154621154622154623154624154625154626154627154628154629154630154631154632154633154634154635154636154637154638154639154640154641154642154643154644154645154646154647154648154649154650154651154652154653154654154655154656154657154658154659154660154661154662154663154664154665154666154667154668154669154670154671154672154673154674154675154676154677154678154679154680154681154682154683154684154685154686154687154688154689154690154691154692154693154694154695154696154697154698154699154700154701154702154703154704154705154706154707154708154709154710154711154712154713154714154715154716154717154718154719154720154721154722154723154724154725154726154727154728154729154730154731154732154733154734154735154736154737154738154739154740154741154742154743154744154745154746154747154748154749154750154751154752154753154754154755154756154757154758154759154760154761154762154763154764154765154766154767154768154769154770154771154772154773154774154775154776154777154778154779154780154781154782154783154784154785154786154787154788154789154790154791154792154793154794154795154796154797154798154799154800154801154802154803154804154805154806154807154808154809154810154811154812154813154814154815154816154817154818154819154820154821154822154823154824154825154826154827154828154829154830154831154832154833154834154835154836154837154838154839154840154841154842154843154844154845154846154847154848154849154850154851154852154853154854154855154856154857154858154859154860154861154862154863154864154865154866154867154868154869154870154871154872154873154874154875154876154877154878154879154880154881154882154883154884154885154886154887154888154889154890154891154892154893154894154895154896154897154898154899154900154901154902154903154904154905154906154907154908154909154910154911154912154913154914154915154916154917154918154919154920154921154922154923154924154925154926154927154928154929154930154931154932154933154934154935154936154937154938154939154940154941154942154943154944154945154946154947154948154949154950154951154952154953154954154955154956154957154958154959154960154961154962154963154964154965154966154967154968154969154970154971154972154973154974154975154976154977154978154979154980154981154982154983154984154985154986154987154988154989154990154991154992154993154994154995154996154997154998154999155000155001155002155003155004155005155006155007155008155009155010155011155012155013155014155015155016155017155018155019155020155021155022155023155024155025155026155027155028155029155030155031155032155033155034155035155036155037155038155039155040155041155042155043155044155045155046155047155048155049155050155051155052155053155054155055155056155057155058155059155060155061155062155063155064155065155066155067155068155069155070155071155072155073155074155075155076155077155078155079155080155081155082155083155084155085155086155087155088155089155090155091155092155093155094155095155096155097155098155099155100155101155102155103155104155105155106155107155108155109155110155111155112155113155114155115155116155117155118155119155120155121155122155123155124155125155126155127155128155129155130155131155132155133155134155135155136155137155138155139155140155141155142155143155144155145155146155147155148155149155150155151155152155153155154155155155156155157155158155159155160155161155162155163155164155165155166155167155168155169155170155171155172155173155174155175155176155177155178155179155180155181155182155183155184155185155186155187155188155189155190155191155192155193155194155195155196155197155198155199155200155201155202155203155204155205155206155207155208155209155210155211155212155213155214155215155216155217155218155219155220155221155222155223155224155225155226155227155228155229155230155231155232155233155234155235155236155237155238155239155240155241155242155243155244155245155246155247155248155249155250155251155252155253155254155255155256155257155258155259155260155261155262155263155264155265155266155267155268155269155270155271155272155273155274155275155276155277155278155279155280155281155282155283155284155285155286155287155288155289155290155291155292155293155294155295155296155297155298155299155300155301155302155303155304155305155306155307155308155309155310155311155312155313155314155315155316155317155318155319155320155321155322155323155324155325155326155327155328155329155330155331155332155333155334155335155336155337155338155339155340155341155342155343155344155345155346155347155348155349155350155351155352155353155354155355155356155357155358155359155360155361155362155363155364155365155366155367155368155369155370155371155372155373155374155375155376155377155378155379155380155381155382155383155384155385155386155387155388155389155390155391155392155393155394155395155396155397155398155399155400155401155402155403155404155405155406155407155408155409155410155411155412155413155414155415155416155417155418155419155420155421155422155423155424155425155426155427155428155429155430155431155432155433155434155435155436155437155438155439155440155441155442155443155444155445155446155447155448155449155450155451155452155453155454155455155456155457155458155459155460155461155462155463155464155465155466155467155468155469155470155471155472155473155474155475155476155477155478155479155480155481155482155483155484155485155486155487155488155489155490155491155492155493155494155495155496155497155498155499155500155501155502155503155504155505155506155507155508155509155510155511155512155513155514155515155516155517155518155519155520155521155522155523155524155525155526155527155528155529155530155531155532155533155534155535155536155537155538155539155540155541155542155543155544155545155546155547155548155549155550155551155552155553155554155555155556155557155558155559155560155561155562155563155564155565155566155567155568155569155570155571155572155573155574155575155576155577155578155579155580155581155582155583155584155585155586155587155588155589155590155591155592155593155594155595155596155597155598155599155600155601155602155603155604155605155606155607155608155609155610155611155612155613155614155615155616155617155618155619155620155621155622155623155624155625155626155627155628155629155630155631155632155633155634155635155636155637155638155639155640155641155642155643155644155645155646155647155648155649155650155651155652155653155654155655155656155657155658155659155660155661155662155663155664155665155666155667155668155669155670155671155672155673155674155675155676155677155678155679155680155681155682155683155684155685155686155687155688155689155690155691155692155693155694155695155696155697155698155699155700155701155702155703155704155705155706155707155708155709155710155711155712155713155714155715155716155717155718155719155720155721155722155723155724155725155726155727155728155729155730155731155732155733155734155735155736155737155738155739155740155741155742155743155744155745155746155747155748155749155750155751155752155753155754155755155756155757155758155759155760155761155762155763155764155765155766155767155768155769155770155771155772155773155774155775155776155777155778155779155780155781155782155783155784155785155786155787155788155789155790155791155792155793155794155795155796155797155798155799155800155801155802155803155804155805155806155807155808155809155810155811155812155813155814155815155816155817155818155819155820155821155822155823155824155825155826155827155828155829155830155831155832155833155834155835155836155837155838155839155840155841155842155843155844155845155846155847155848155849155850155851155852155853155854155855155856155857155858155859155860155861155862155863155864155865155866155867155868155869155870155871155872155873155874155875155876155877155878155879155880155881155882155883155884155885155886155887155888155889155890155891155892155893155894155895155896155897155898155899155900155901155902155903155904155905155906155907155908155909155910155911155912155913155914155915155916155917155918155919155920155921155922155923155924155925155926155927155928155929155930155931155932155933155934155935155936155937155938155939155940155941155942155943155944155945155946155947155948155949155950155951155952155953155954155955155956155957155958155959155960155961155962155963155964155965155966155967155968155969155970155971155972155973155974155975155976155977155978155979155980155981155982155983155984155985155986155987155988155989155990155991155992155993155994155995155996155997155998155999156000156001156002156003156004156005156006156007156008156009156010156011156012156013156014156015156016156017156018156019156020156021156022156023156024156025156026156027156028156029156030156031156032156033156034156035156036156037156038156039156040156041156042156043156044156045156046156047156048156049156050156051156052156053156054156055156056156057156058156059156060156061156062156063156064156065156066156067156068156069156070156071156072156073156074156075156076156077156078156079156080156081156082156083156084156085156086156087156088156089156090156091156092156093156094156095156096156097156098156099156100156101156102156103156104156105156106156107156108156109156110156111156112156113156114156115156116156117156118156119156120156121156122156123156124156125156126156127156128156129156130156131156132156133156134156135156136156137156138156139156140156141156142156143156144156145156146156147156148156149156150156151156152156153156154156155156156156157156158156159156160156161156162156163156164156165156166156167156168156169156170156171156172156173156174156175156176156177156178156179156180156181156182156183156184156185156186156187156188156189156190156191156192156193156194156195156196156197156198156199156200156201156202156203156204156205156206156207156208156209156210156211156212156213156214156215156216156217156218156219156220156221156222156223156224156225156226156227156228156229156230156231156232156233156234156235156236156237156238156239156240156241156242156243156244156245156246156247156248156249156250156251156252156253156254156255156256156257156258156259156260156261156262156263156264156265156266156267156268156269156270156271156272156273156274156275156276156277156278156279156280156281156282156283156284156285156286156287156288156289156290156291156292156293156294156295156296156297156298156299156300156301156302156303156304156305156306156307156308156309156310156311156312156313156314156315156316156317156318156319156320156321156322156323156324156325156326156327156328156329156330156331156332156333156334156335156336156337156338156339156340156341156342156343156344156345156346156347156348156349156350156351156352156353156354156355156356156357156358156359156360156361156362156363156364156365156366156367156368156369156370156371156372156373156374156375156376156377156378156379156380156381156382156383156384156385156386156387156388156389156390156391156392156393156394156395156396156397156398156399156400156401156402156403156404156405156406156407156408156409156410156411156412156413156414156415156416156417156418156419156420156421156422156423156424156425156426156427156428156429156430156431156432156433156434156435156436156437156438156439156440156441156442156443156444156445156446156447156448156449156450156451156452156453156454156455156456156457156458156459156460156461156462156463156464156465156466156467156468156469156470156471156472156473156474156475156476156477156478156479156480156481156482156483156484156485156486156487156488156489156490156491156492156493156494156495156496156497156498156499156500156501156502156503156504156505156506156507156508156509156510156511156512156513156514156515156516156517156518156519156520156521156522156523156524156525156526156527156528156529156530156531156532156533156534156535156536156537156538156539156540156541156542156543156544156545156546156547156548156549156550156551156552156553156554156555156556156557156558156559156560156561156562156563156564156565156566156567156568156569156570156571156572156573156574156575156576156577156578156579156580156581156582156583156584156585156586156587156588156589156590156591156592156593156594156595156596156597156598156599156600156601156602156603156604156605156606156607156608156609156610156611156612156613156614156615156616156617156618156619156620156621156622156623156624156625156626156627156628156629156630156631156632156633156634156635156636156637156638156639156640156641156642156643156644156645156646156647156648156649156650156651156652156653156654156655156656156657156658156659156660156661156662156663156664156665156666156667156668156669156670156671156672156673156674156675156676156677156678156679156680156681156682156683156684156685156686156687156688156689156690156691156692156693156694156695156696156697156698156699156700156701156702156703156704156705156706156707156708156709156710156711156712156713156714156715156716156717156718156719156720156721156722156723156724156725156726156727156728156729156730156731156732156733156734156735156736156737156738156739156740156741156742156743156744156745156746156747156748156749156750156751156752156753156754156755156756156757156758156759156760156761156762156763156764156765156766156767156768156769156770156771156772156773156774156775156776156777156778156779156780156781156782156783156784156785156786156787156788156789156790156791156792156793156794156795156796156797156798156799156800156801156802156803156804156805156806156807156808156809156810156811156812156813156814156815156816156817156818156819156820156821156822156823156824156825156826156827156828156829156830156831156832156833156834156835156836156837156838156839156840156841156842156843156844156845156846156847156848156849156850156851156852156853156854156855156856156857156858156859156860156861156862156863156864156865156866156867156868156869156870156871156872156873156874156875156876156877156878156879156880156881156882156883156884156885156886156887156888156889156890156891156892156893156894156895156896156897156898156899156900156901156902156903156904156905156906156907156908156909156910156911156912156913156914156915156916156917156918156919156920156921156922156923156924156925156926156927156928156929156930156931156932156933156934156935156936156937156938156939156940156941156942156943156944156945156946156947156948156949156950156951156952156953156954156955156956156957156958156959156960156961156962156963156964156965156966156967156968156969156970156971156972156973156974156975156976156977156978156979156980156981156982156983156984156985156986156987156988156989156990156991156992156993156994156995156996156997156998156999157000157001157002157003157004157005157006157007157008157009157010157011157012157013157014157015157016157017157018157019157020157021157022157023157024157025157026157027157028157029157030157031157032157033157034157035157036157037157038157039157040157041157042157043157044157045157046157047157048157049157050157051157052157053157054157055157056157057157058157059157060157061157062157063157064157065157066157067157068157069157070157071157072157073157074157075157076157077157078157079157080157081157082157083157084157085157086157087157088157089157090157091157092157093157094157095157096157097157098157099157100157101157102157103157104157105157106157107157108157109157110157111157112157113157114157115157116157117157118157119157120157121157122157123157124157125157126157127157128157129157130157131157132157133157134157135157136157137157138157139157140157141157142157143157144157145157146157147157148157149157150157151157152157153157154157155157156157157157158157159157160157161157162157163157164157165157166157167157168157169157170157171157172157173157174157175157176157177157178157179157180157181157182157183157184157185157186157187157188157189157190157191157192157193157194157195157196157197157198157199157200157201157202157203157204157205157206157207157208157209157210157211157212157213157214157215157216157217157218157219157220157221157222157223157224157225157226157227157228157229157230157231157232157233157234157235157236157237157238157239157240157241157242157243157244157245157246157247157248157249157250157251157252157253157254157255157256157257157258157259157260157261157262157263157264157265157266157267157268157269157270157271157272157273157274157275157276157277157278157279157280157281157282157283157284157285157286157287157288157289157290157291157292157293157294157295157296157297157298157299157300157301157302157303157304157305157306157307157308157309157310157311157312157313157314157315157316157317157318157319157320157321157322157323157324157325157326157327157328157329157330157331157332157333157334157335157336157337157338157339157340157341157342157343157344157345157346157347157348157349157350157351157352157353157354157355157356157357157358157359157360157361157362157363157364157365157366157367157368157369157370157371157372157373157374157375157376157377157378157379157380157381157382157383157384157385157386157387157388157389157390157391157392157393157394157395157396157397157398157399157400157401157402157403157404157405157406157407157408157409157410157411157412157413157414157415157416157417157418157419157420157421157422157423157424157425157426157427157428157429157430157431157432157433157434157435157436157437157438157439157440157441157442157443157444157445157446157447157448157449157450157451157452157453157454157455157456157457157458157459157460157461157462157463157464157465157466157467157468157469157470157471157472157473157474157475157476157477157478157479157480157481157482157483157484157485157486157487157488157489157490157491157492157493157494157495157496157497157498157499157500157501157502157503157504157505157506157507157508157509157510157511157512157513157514157515157516157517157518157519157520157521157522157523157524157525157526157527157528157529157530157531157532157533157534157535157536157537157538157539157540157541157542157543157544157545157546157547157548157549157550157551157552157553157554157555157556157557157558157559157560157561157562157563157564157565157566157567157568157569157570157571157572157573157574157575157576157577157578157579157580157581157582157583157584157585157586157587157588157589157590157591157592157593157594157595157596157597157598157599157600157601157602157603157604157605157606157607157608157609157610157611157612157613157614157615157616157617157618157619157620157621157622157623157624157625157626157627157628157629157630157631157632157633157634157635157636157637157638157639157640157641157642157643157644157645157646157647157648157649157650157651157652157653157654157655157656157657157658157659157660157661157662157663157664157665157666157667157668157669157670157671157672157673157674157675157676157677157678157679157680157681157682157683157684157685157686157687157688157689157690157691157692157693157694157695157696157697157698157699157700157701157702157703157704157705157706157707157708157709157710157711157712157713157714157715157716157717157718157719157720157721157722157723157724157725157726157727157728157729157730157731157732157733157734157735157736157737157738157739157740157741157742157743157744157745157746157747157748157749157750157751157752157753157754157755157756157757157758157759157760157761157762157763157764157765157766157767157768157769157770157771157772157773157774157775157776157777157778157779157780157781157782157783157784157785157786157787157788157789157790157791157792157793157794157795157796157797157798157799157800157801157802157803157804157805157806157807157808157809157810157811157812157813157814157815157816157817157818157819157820157821157822157823157824157825157826157827157828157829157830157831157832157833157834157835157836157837157838157839157840157841157842157843157844157845157846157847157848157849157850157851157852157853157854157855157856157857157858157859157860157861157862157863157864157865157866157867157868157869157870157871157872157873157874157875157876157877157878157879157880157881157882157883157884157885157886157887157888157889157890157891157892157893157894157895157896157897157898157899157900157901157902157903157904157905157906157907157908157909157910157911157912157913157914157915157916157917157918157919157920157921157922157923157924157925157926157927157928157929157930157931157932157933157934157935157936157937157938157939157940157941157942157943157944157945157946157947157948157949157950157951157952157953157954157955157956157957157958157959157960157961157962157963157964157965157966157967157968157969157970157971157972157973157974157975157976157977157978157979157980157981157982157983157984157985157986157987157988157989157990157991157992157993157994157995157996157997157998157999158000158001158002158003158004158005158006158007158008158009158010158011158012158013158014158015158016158017158018158019158020158021158022158023158024158025158026158027158028158029158030158031158032158033158034158035158036158037158038158039158040158041158042158043158044158045158046158047158048158049158050158051158052158053158054158055158056158057158058158059158060158061158062158063158064158065158066158067158068158069158070158071158072158073158074158075158076158077158078158079158080158081158082158083158084158085158086158087158088158089158090158091158092158093158094158095158096158097158098158099158100158101158102158103158104158105158106158107158108158109158110158111158112158113158114158115158116158117158118158119158120158121158122158123158124158125158126158127158128158129158130158131158132158133158134158135158136158137158138158139158140158141158142158143158144158145158146158147158148158149158150158151158152158153158154158155158156158157158158158159158160158161158162158163158164158165158166158167158168158169158170158171158172158173158174158175158176158177158178158179158180158181158182158183158184158185158186158187158188158189158190158191158192158193158194158195158196158197158198158199158200158201158202158203158204158205158206158207158208158209158210158211158212158213158214158215158216158217158218158219158220158221158222158223158224158225158226158227158228158229158230158231158232158233158234158235158236158237158238158239158240158241158242158243158244158245158246158247158248158249158250158251158252158253158254158255158256158257158258158259158260158261158262158263158264158265158266158267158268158269158270158271158272158273158274158275158276158277158278158279158280158281158282158283158284158285158286158287158288158289158290158291158292158293158294158295158296158297158298158299158300158301158302158303158304158305158306158307158308158309158310158311158312158313158314158315158316158317158318158319158320158321158322158323158324158325158326158327158328158329158330158331158332158333158334158335158336158337158338158339158340158341158342158343158344158345158346158347158348158349158350158351158352158353158354158355158356158357158358158359158360158361158362158363158364158365158366158367158368158369158370158371158372158373158374158375158376158377158378158379158380158381158382158383158384158385158386158387158388158389158390158391158392158393158394158395158396158397158398158399158400158401158402158403158404158405158406158407158408158409158410158411158412158413158414158415158416158417158418158419158420158421158422158423158424158425158426158427158428158429158430158431158432158433158434158435158436158437158438158439158440158441158442158443158444158445158446158447158448158449158450158451158452158453158454158455158456158457158458158459158460158461158462158463158464158465158466158467158468158469158470158471158472158473158474158475158476158477158478158479158480158481158482158483158484158485158486158487158488158489158490158491158492158493158494158495158496158497158498158499158500158501158502158503158504158505158506158507158508158509158510158511158512158513158514158515158516158517158518158519158520158521158522158523158524158525158526158527158528158529158530158531158532158533158534158535158536158537158538158539158540158541158542158543158544158545158546158547158548158549158550158551158552158553158554158555158556158557158558158559158560158561158562158563158564158565158566158567158568158569158570158571158572158573158574158575158576158577158578158579158580158581158582158583158584158585158586158587158588158589158590158591158592158593158594158595158596158597158598158599158600158601158602158603158604158605158606158607158608158609158610158611158612158613158614158615158616158617158618158619158620158621158622158623158624158625158626158627158628158629158630158631158632158633158634158635158636158637158638158639158640158641158642158643158644158645158646158647158648158649158650158651158652158653158654158655158656158657158658158659158660158661158662158663158664158665158666158667158668158669158670158671158672158673158674158675158676158677158678158679158680158681158682158683158684158685158686158687158688158689158690158691158692158693158694158695158696158697158698158699158700158701158702158703158704158705158706158707158708158709158710158711158712158713158714158715158716158717158718158719158720158721158722158723158724158725158726158727158728158729158730158731158732158733158734158735158736158737158738158739158740158741158742158743158744158745158746158747158748158749158750158751158752158753158754158755158756158757158758158759158760158761158762158763158764158765158766158767158768158769158770158771158772158773158774158775158776158777158778158779158780158781158782158783158784158785158786158787158788158789158790158791158792158793158794158795158796158797158798158799158800158801158802158803158804158805158806158807158808158809158810158811158812158813158814158815158816158817158818158819158820158821158822158823158824158825158826158827158828158829158830158831158832158833158834158835158836158837158838158839158840158841158842158843158844158845158846158847158848158849158850158851158852158853158854158855158856158857158858158859158860158861158862158863158864158865158866158867158868158869158870158871158872158873158874158875158876158877158878158879158880158881158882158883158884158885158886158887158888158889158890158891158892158893158894158895158896158897158898158899158900158901158902158903158904158905158906158907158908158909158910158911158912158913158914158915158916158917158918158919158920158921158922158923158924158925158926158927158928158929158930158931158932158933158934158935158936158937158938158939158940158941158942158943158944158945158946158947158948158949158950158951158952158953158954158955158956158957158958158959158960158961158962158963158964158965158966158967158968158969158970158971158972158973158974158975158976158977158978158979158980158981158982158983158984158985158986158987158988158989158990158991158992158993158994158995158996158997158998158999159000159001159002159003159004159005159006159007159008159009159010159011159012159013159014159015159016159017159018159019159020159021159022159023159024159025159026159027159028159029159030159031159032159033159034159035159036159037159038159039159040159041159042159043159044159045159046159047159048159049159050159051159052159053159054159055159056159057159058159059159060159061159062159063159064159065159066159067159068159069159070159071159072159073159074159075159076159077159078159079159080159081159082159083159084159085159086159087159088159089159090159091159092159093159094159095159096159097159098159099159100159101159102159103159104159105159106159107159108159109159110159111159112159113159114159115159116159117159118159119159120159121159122159123159124159125159126159127159128159129159130159131159132159133159134159135159136159137159138159139159140159141159142159143159144159145159146159147159148159149159150159151159152159153159154159155159156159157159158159159159160159161159162159163159164159165159166159167159168159169159170159171159172159173159174159175159176159177159178159179159180159181159182159183159184159185159186159187159188159189159190159191159192159193159194159195159196159197159198159199159200159201159202159203159204159205159206159207159208159209159210159211159212159213159214159215159216159217159218159219159220159221159222159223159224159225159226159227159228159229159230159231159232159233159234159235159236159237159238159239159240159241159242159243159244159245159246159247159248159249159250159251159252159253159254159255159256159257159258159259159260159261159262159263159264159265159266159267159268159269159270159271159272159273159274159275159276159277159278159279159280159281159282159283159284159285159286159287159288159289159290159291159292159293159294159295159296159297159298159299159300159301159302159303159304159305159306159307159308159309159310159311159312159313159314159315159316159317159318159319159320159321159322159323159324159325159326159327159328159329159330159331159332159333159334159335159336159337159338159339159340159341159342159343159344159345159346159347159348159349159350159351159352159353159354159355159356159357159358159359159360159361159362159363159364159365159366159367159368159369159370159371159372159373159374159375159376159377159378159379159380159381159382159383159384159385159386159387159388159389159390159391159392159393159394159395159396159397159398159399159400159401159402159403159404159405159406159407159408159409159410159411159412159413159414159415159416159417159418159419159420159421159422159423159424159425159426159427159428159429159430159431159432159433159434159435159436159437159438159439159440159441159442159443159444159445159446159447159448159449159450159451159452159453159454159455159456159457159458159459159460159461159462159463159464159465159466159467159468159469159470159471159472159473159474159475159476159477159478159479159480159481159482159483159484159485159486159487159488159489159490159491159492159493159494159495159496159497159498159499159500159501159502159503159504159505159506159507159508159509159510159511159512159513159514159515159516159517159518159519159520159521159522159523159524159525159526159527159528159529159530159531159532159533159534159535159536159537159538159539159540159541159542159543159544159545159546159547159548159549159550159551159552159553159554159555159556159557159558159559159560159561159562159563159564159565159566159567159568159569159570159571159572159573159574159575159576159577159578159579159580159581159582159583159584159585159586159587159588159589159590159591159592159593159594159595159596159597159598159599159600159601159602159603159604159605159606159607159608159609159610159611159612159613159614159615159616159617159618159619159620159621159622159623159624159625159626159627159628159629159630159631159632159633159634159635159636159637159638159639159640159641159642159643159644159645159646159647159648159649159650159651159652159653159654159655159656159657159658159659159660159661159662159663159664159665159666159667159668159669159670159671159672159673159674159675159676159677159678159679159680159681159682159683159684159685159686159687159688159689159690159691159692159693159694159695159696159697159698159699159700159701159702159703159704159705159706159707159708159709159710159711159712159713159714159715159716159717159718159719159720159721159722159723159724159725159726159727159728159729159730159731159732159733159734159735159736159737159738159739159740159741159742159743159744159745159746159747159748159749159750159751159752159753159754159755159756159757159758159759159760159761159762159763159764159765159766159767159768159769159770159771159772159773159774159775159776159777159778159779159780159781159782159783159784159785159786159787159788159789159790159791159792159793159794159795159796159797159798159799159800159801159802159803159804159805159806159807159808159809159810159811159812159813159814159815159816159817159818159819159820159821159822159823159824159825159826159827159828159829159830159831159832159833159834159835159836159837159838159839159840159841159842159843159844159845159846159847159848159849159850159851159852159853159854159855159856159857159858159859159860159861159862159863159864159865159866159867159868159869159870159871159872159873159874159875159876159877159878159879159880159881159882159883159884159885159886159887159888159889159890159891159892159893159894159895159896159897159898159899159900159901159902159903159904159905159906159907159908159909159910159911159912159913159914159915159916159917159918159919159920159921159922159923159924159925159926159927159928159929159930159931159932159933159934159935159936159937159938159939159940159941159942159943159944159945159946159947159948159949159950159951159952159953159954159955159956159957159958159959159960159961159962159963159964159965159966159967159968159969159970159971159972159973159974159975159976159977159978159979159980159981159982159983159984159985159986159987159988159989159990159991159992159993159994159995159996159997159998159999160000160001160002160003160004160005160006160007160008160009160010160011160012160013160014160015160016160017160018160019160020160021160022160023160024160025160026160027160028160029160030160031160032160033160034160035160036160037160038160039160040160041160042160043160044160045160046160047160048160049160050160051160052160053160054160055160056160057160058160059160060160061160062160063160064160065160066160067160068160069160070160071160072160073160074160075160076160077160078160079160080160081160082160083160084160085160086160087160088160089160090160091160092160093160094160095160096160097160098160099160100160101160102160103160104160105160106160107160108160109160110160111160112160113160114160115160116160117160118160119160120160121160122160123160124160125160126160127160128160129160130160131160132160133160134160135160136160137160138160139160140160141160142160143160144160145160146160147160148160149160150160151160152160153160154160155160156160157160158160159160160160161160162160163160164160165160166160167160168160169160170160171160172160173160174160175160176160177160178160179160180160181160182160183160184160185160186160187160188160189160190160191160192160193160194160195160196160197160198160199160200160201160202160203160204160205160206160207160208160209160210160211160212160213160214160215160216160217160218160219160220160221160222160223160224160225160226160227160228160229160230160231160232160233160234160235160236160237160238160239160240160241160242160243160244160245160246160247160248160249160250160251160252160253160254160255160256160257160258160259160260160261160262160263160264160265160266160267160268160269160270160271160272160273160274160275160276160277160278160279160280160281160282160283160284160285160286160287160288160289160290160291160292160293160294160295160296160297160298160299160300160301160302160303160304160305160306160307160308160309160310160311160312160313160314160315160316160317160318160319160320160321160322160323160324160325160326160327160328160329160330160331160332160333160334160335160336160337160338160339160340160341160342160343160344160345160346160347160348160349160350160351160352160353160354160355160356160357160358160359160360160361160362160363160364160365160366160367160368160369160370160371160372160373160374160375160376160377160378160379160380160381160382160383160384160385160386160387160388160389160390160391160392160393160394160395160396160397160398160399160400160401160402160403160404160405160406160407160408160409160410160411160412160413160414160415160416160417160418160419160420160421160422160423160424160425160426160427160428160429160430160431160432160433160434160435160436160437160438160439160440160441160442160443160444160445160446160447160448160449160450160451160452160453160454160455160456160457160458160459160460160461160462160463160464160465160466160467160468160469160470160471160472160473160474160475160476160477160478160479160480160481160482160483160484160485160486160487160488160489160490160491160492160493160494160495160496160497160498160499160500160501160502160503160504160505160506160507160508160509160510160511160512160513160514160515160516160517160518160519160520160521160522160523160524160525160526160527160528160529160530160531160532160533160534160535160536160537160538160539160540160541160542160543160544160545160546160547160548160549160550160551160552160553160554160555160556160557160558160559160560160561160562160563160564160565160566160567160568160569160570160571160572160573160574160575160576160577160578160579160580160581160582160583160584160585160586160587160588160589160590160591160592160593160594160595160596160597160598160599160600160601160602160603160604160605160606160607160608160609160610160611160612160613160614160615160616160617160618160619160620160621160622160623160624160625160626160627160628160629160630160631160632160633160634160635160636160637160638160639160640160641160642160643160644160645160646160647160648160649160650160651160652160653160654160655160656160657160658160659160660160661160662160663160664160665160666160667160668160669160670160671160672160673160674160675160676160677160678160679160680160681160682160683160684160685160686160687160688160689160690160691160692160693160694160695160696160697160698160699160700160701160702160703160704160705160706160707160708160709160710160711160712160713160714160715160716160717160718160719160720160721160722160723160724160725160726160727160728160729160730160731160732160733160734160735160736160737160738160739160740160741160742160743160744160745160746160747160748160749160750160751160752160753160754160755160756160757160758160759160760160761160762160763160764160765160766160767160768160769160770160771160772160773160774160775160776160777160778160779160780160781160782160783160784160785160786160787160788160789160790160791160792160793160794160795160796160797160798160799160800160801160802160803160804160805160806160807160808160809160810160811160812160813160814160815160816160817160818160819160820160821160822160823160824160825160826160827160828160829160830160831160832160833160834160835160836160837160838160839160840160841160842160843160844160845160846160847160848160849160850160851160852160853160854160855160856160857160858160859160860160861160862160863160864160865160866160867160868160869160870160871160872160873160874160875160876160877160878160879160880160881160882160883160884160885160886160887160888160889160890160891160892160893160894160895160896160897160898160899160900160901160902160903160904160905160906160907160908160909160910160911160912160913160914160915160916160917160918160919160920160921160922160923160924160925160926160927160928160929160930160931160932160933160934160935160936160937160938160939160940160941160942160943160944160945160946160947160948160949160950160951160952160953160954160955160956160957160958160959160960160961160962160963160964160965160966160967160968160969160970160971160972160973160974160975160976160977160978160979160980160981160982160983160984160985160986160987160988160989160990160991160992160993160994160995160996160997160998160999161000161001161002161003161004161005161006161007161008161009161010161011161012161013161014161015161016161017161018161019161020161021161022161023161024161025161026161027161028161029161030161031161032161033161034161035161036161037161038161039161040161041161042161043161044161045161046161047161048161049161050161051161052161053161054161055161056161057161058161059161060161061161062161063161064161065161066161067161068161069161070161071161072161073161074161075161076161077161078161079161080161081161082161083161084161085161086161087161088161089161090161091161092161093161094161095161096161097161098161099161100161101161102161103161104161105161106161107161108161109161110161111161112161113161114161115161116161117161118161119161120161121161122161123161124161125161126161127161128161129161130161131161132161133161134161135161136161137161138161139161140161141161142161143161144161145161146161147161148161149161150161151161152161153161154161155161156161157161158161159161160161161161162161163161164161165161166161167161168161169161170161171161172161173161174161175161176161177161178161179161180161181161182161183161184161185161186161187161188161189161190161191161192161193161194161195161196161197161198161199161200161201161202161203161204161205161206161207161208161209161210161211161212161213161214161215161216161217161218161219161220161221161222161223161224161225161226161227161228161229161230161231161232161233161234161235161236161237161238161239161240161241161242161243161244161245161246161247161248161249161250161251161252161253161254161255161256161257161258161259161260161261161262161263161264161265161266161267161268161269161270161271161272161273161274161275161276161277161278161279161280161281161282161283161284161285161286161287161288161289161290161291161292161293161294161295161296161297161298161299161300161301161302161303161304161305161306161307161308161309161310161311161312161313161314161315161316161317161318161319161320161321161322161323161324161325161326161327161328161329161330161331161332161333161334161335161336161337161338161339161340161341161342161343161344161345161346161347161348161349161350161351161352161353161354161355161356161357161358161359161360161361161362161363161364161365161366161367161368161369161370161371161372161373161374161375161376161377161378161379161380161381161382161383161384161385161386161387161388161389161390161391161392161393161394161395161396161397161398161399161400161401161402161403161404161405161406161407161408161409161410161411161412161413161414161415161416161417161418161419161420161421161422161423161424161425161426161427161428161429161430161431161432161433161434161435161436161437161438161439161440161441161442161443161444161445161446161447161448161449161450161451161452161453161454161455161456161457161458161459161460161461161462161463161464161465161466161467161468161469161470161471161472161473161474161475161476161477161478161479161480161481161482161483161484161485161486161487161488161489161490161491161492161493161494161495161496161497161498161499161500161501161502161503161504161505161506161507161508161509161510161511161512161513161514161515161516161517161518161519161520161521161522161523161524161525161526161527161528161529161530161531161532161533161534161535161536161537161538161539161540161541161542161543161544161545161546161547161548161549161550161551161552161553161554161555161556161557161558161559161560161561161562161563161564161565161566161567161568161569161570161571161572161573161574161575161576161577161578161579161580161581161582161583161584161585161586161587161588161589161590161591161592161593161594161595161596161597161598161599161600161601161602161603161604161605161606161607161608161609161610161611161612161613161614161615161616161617161618161619161620161621161622161623161624161625161626161627161628161629161630161631161632161633161634161635161636161637161638161639161640161641161642161643161644161645161646161647161648161649161650161651161652161653161654161655161656161657161658161659161660161661161662161663161664161665161666161667161668161669161670161671161672161673161674161675161676161677161678161679161680161681161682161683161684161685161686161687161688161689161690161691161692161693161694161695161696161697161698161699161700161701161702161703161704161705161706161707161708161709161710161711161712161713161714161715161716161717161718161719161720161721161722161723161724161725161726161727161728161729161730161731161732161733161734161735161736161737161738161739161740161741161742161743161744161745161746161747161748161749161750161751161752161753161754161755161756161757161758161759161760161761161762161763161764161765161766161767161768161769161770161771161772161773161774161775161776161777161778161779161780161781161782161783161784161785161786161787161788161789161790161791161792161793161794161795161796161797161798161799161800161801161802161803161804161805161806161807161808161809161810161811161812161813161814161815161816161817161818161819161820161821161822161823161824161825161826161827161828161829161830161831161832161833161834161835161836161837161838161839161840161841161842161843161844161845161846161847161848161849161850161851161852161853161854161855161856161857161858161859161860161861161862161863161864161865161866161867161868161869161870161871161872161873161874161875161876161877161878161879161880161881161882161883161884161885161886161887161888161889161890161891161892161893161894161895161896161897161898161899161900161901161902161903161904161905161906161907161908161909161910161911161912161913161914161915161916161917161918161919161920161921161922161923161924161925161926161927161928161929161930161931161932161933161934161935161936161937161938161939161940161941161942161943161944161945161946161947161948161949161950161951161952161953161954161955161956161957161958161959161960161961161962161963161964161965161966161967161968161969161970161971161972161973161974161975161976161977161978161979161980161981161982161983161984161985161986161987161988161989161990161991161992161993161994161995161996161997161998161999162000162001162002162003162004162005162006162007162008162009162010162011162012162013162014162015162016162017162018162019162020162021162022162023162024162025162026162027162028162029162030162031162032162033162034162035162036162037162038162039162040162041162042162043162044162045162046162047162048162049162050162051162052162053162054162055162056162057162058162059162060162061162062162063162064162065162066162067162068162069162070162071162072162073162074162075162076162077162078162079162080162081162082162083162084162085162086162087162088162089162090162091162092162093162094162095162096162097162098162099162100162101162102162103162104162105162106162107162108162109162110162111162112162113162114162115162116162117162118162119162120162121162122162123162124162125162126162127162128162129162130162131162132162133162134162135162136162137162138162139162140162141162142162143162144162145162146162147162148162149162150162151162152162153162154162155162156162157162158162159162160162161162162162163162164162165162166162167162168162169162170162171162172162173162174162175162176162177162178162179162180162181162182162183162184162185162186162187162188162189162190162191162192162193162194162195162196162197162198162199162200162201162202162203162204162205162206162207162208162209162210162211162212162213162214162215162216162217162218162219162220162221162222162223162224162225162226162227162228162229162230162231162232162233162234162235162236162237162238162239162240162241162242162243162244162245162246162247162248162249162250162251162252162253162254162255162256162257162258162259162260162261162262162263162264162265162266162267162268162269162270162271162272162273162274162275162276162277162278162279162280162281162282162283162284162285162286162287162288162289162290162291162292162293162294162295162296162297162298162299162300162301162302162303162304162305162306162307162308162309162310162311162312162313162314162315162316162317162318162319162320162321162322162323162324162325162326162327162328162329162330162331162332162333162334162335162336162337162338162339162340162341162342162343162344162345162346162347162348162349162350162351162352162353162354162355162356162357162358162359162360162361162362162363162364162365162366162367162368162369162370162371162372162373162374162375162376162377162378162379162380162381162382162383162384162385162386162387162388162389162390162391162392162393162394162395162396162397162398162399162400162401162402162403162404162405162406162407162408162409162410162411162412162413162414162415162416162417162418162419162420162421162422162423162424162425162426162427162428162429162430162431162432162433162434162435162436162437162438162439162440162441162442162443162444162445162446162447162448162449162450162451162452162453162454162455162456162457162458162459162460162461162462162463162464162465162466162467162468162469162470162471162472162473162474162475162476162477162478162479162480162481162482162483162484162485162486162487162488162489162490162491162492162493162494162495162496162497162498162499162500162501162502162503162504162505162506162507162508162509162510162511162512162513162514162515162516162517162518162519162520162521162522162523162524162525162526162527162528162529162530162531162532162533162534162535162536162537162538162539162540162541162542162543162544162545162546162547162548162549162550162551162552162553162554162555162556162557162558162559162560162561162562162563162564162565162566162567162568162569162570162571162572162573162574162575162576162577162578162579162580162581162582162583162584162585162586162587162588162589162590162591162592162593162594162595162596162597162598162599162600162601162602162603162604162605162606162607162608162609162610162611162612162613162614162615162616162617162618162619162620162621162622162623162624162625162626162627162628162629162630162631162632162633162634162635162636162637162638162639162640162641162642162643162644162645162646162647162648162649162650162651162652162653162654162655162656162657162658162659162660162661162662162663162664162665162666162667162668162669162670162671162672162673162674162675162676162677162678162679162680162681162682162683162684162685162686162687162688162689162690162691162692162693162694162695162696162697162698162699162700162701162702162703162704162705162706162707162708162709162710162711162712162713162714162715162716162717162718162719162720162721162722162723162724162725162726162727162728162729162730162731162732162733162734162735162736162737162738162739162740162741162742162743162744162745162746162747162748162749162750162751162752162753162754162755162756162757162758162759162760162761162762162763162764162765162766162767162768162769162770162771162772162773162774162775162776162777162778162779162780162781162782162783162784162785162786162787162788162789162790162791162792162793162794162795162796162797162798162799162800162801162802162803162804162805162806162807162808162809162810162811162812162813162814162815162816162817162818162819162820162821162822162823162824162825162826162827162828162829162830162831162832162833162834162835162836162837162838162839162840162841162842162843162844162845162846162847162848162849162850162851162852162853162854162855162856162857162858162859162860162861162862162863162864162865162866162867162868162869162870162871162872162873162874162875162876162877162878162879162880162881162882162883162884162885162886162887162888162889162890162891162892162893162894162895162896162897162898162899162900162901162902162903162904162905162906162907162908162909162910162911162912162913162914162915162916162917162918162919162920162921162922162923162924162925162926162927162928162929162930162931162932162933162934162935162936162937162938162939162940162941162942162943162944162945162946162947162948162949162950162951162952162953162954162955162956162957162958162959162960162961162962162963162964162965162966162967162968162969162970162971162972162973162974162975162976162977162978162979162980162981162982162983162984162985162986162987162988162989162990162991162992162993162994162995162996162997162998162999163000163001163002163003163004163005163006163007163008163009163010163011163012163013163014163015163016163017163018163019163020163021163022163023163024163025163026163027163028163029163030163031163032163033163034163035163036163037163038163039163040163041163042163043163044163045163046163047163048163049163050163051163052163053163054163055163056163057163058163059163060163061163062163063163064163065163066163067163068163069163070163071163072163073163074163075163076163077163078163079163080163081163082163083163084163085163086163087163088163089163090163091163092163093163094163095163096163097163098163099163100163101163102163103163104163105163106163107163108163109163110163111163112163113163114163115163116163117163118163119163120163121163122163123163124163125163126163127163128163129163130163131163132163133163134163135163136163137163138163139163140163141163142163143163144163145163146163147163148163149163150163151163152163153163154163155163156163157163158163159163160163161163162163163163164163165163166163167163168163169163170163171163172163173163174163175163176163177163178163179163180163181163182163183163184163185163186163187163188163189163190163191163192163193163194163195163196163197163198163199163200163201163202163203163204163205163206163207163208163209163210163211163212163213163214163215163216163217163218163219163220163221163222163223163224163225163226163227163228163229163230163231163232163233163234163235163236163237163238163239163240163241163242163243163244163245163246163247163248163249163250163251163252163253163254163255163256163257163258163259163260163261163262163263163264163265163266163267163268163269163270163271163272163273163274163275163276163277163278163279163280163281163282163283163284163285163286163287163288163289163290163291163292163293163294163295163296163297163298163299163300163301163302163303163304163305163306163307163308163309163310163311163312163313163314163315163316163317163318163319163320163321163322163323163324163325163326163327163328163329163330163331163332163333163334163335163336163337163338163339163340163341163342163343163344163345163346163347163348163349163350163351163352163353163354163355163356163357163358163359163360163361163362163363163364163365163366163367163368163369163370163371163372163373163374163375163376163377163378163379163380163381163382163383163384163385163386163387163388163389163390163391163392163393163394163395163396163397163398163399163400163401163402163403163404163405163406163407163408163409163410163411163412163413163414163415163416163417163418163419163420163421163422163423163424163425163426163427163428163429163430163431163432163433163434163435163436163437163438163439163440163441163442163443163444163445163446163447163448163449163450163451163452163453163454163455163456163457163458163459163460163461163462163463163464163465163466163467163468163469163470163471163472163473163474163475163476163477163478163479163480163481163482163483163484163485163486163487163488163489163490163491163492163493163494163495163496163497163498163499163500163501163502163503163504163505163506163507163508163509163510163511163512163513163514163515163516163517163518163519163520163521163522163523163524163525163526163527163528163529163530163531163532163533163534163535163536163537163538163539163540163541163542163543163544163545163546163547163548163549163550163551163552163553163554163555163556163557163558163559163560163561163562163563163564163565163566163567163568163569163570163571163572163573163574163575163576163577163578163579163580163581163582163583163584163585163586163587163588163589163590163591163592163593163594163595163596163597163598163599163600163601163602163603163604163605163606163607163608163609163610163611163612163613163614163615163616163617163618163619163620163621163622163623163624163625163626163627163628163629163630163631163632163633163634163635163636163637163638163639163640163641163642163643163644163645163646163647163648163649163650163651163652163653163654163655163656163657163658163659163660163661163662163663163664163665163666163667163668163669163670163671163672163673163674163675163676163677163678163679163680163681163682163683163684163685163686163687163688163689163690163691163692163693163694163695163696163697163698163699163700163701163702163703163704163705163706163707163708163709163710163711163712163713163714163715163716163717163718163719163720163721163722163723163724163725163726163727163728163729163730163731163732163733163734163735163736163737163738163739163740163741163742163743163744163745163746163747163748163749163750163751163752163753163754163755163756163757163758163759163760163761163762163763163764163765163766163767163768163769163770163771163772163773163774163775163776163777163778163779163780163781163782163783163784163785163786163787163788163789163790163791163792163793163794163795163796163797163798163799163800163801163802163803163804163805163806163807163808163809163810163811163812163813163814163815163816163817163818163819163820163821163822163823163824163825163826163827163828163829163830163831163832163833163834163835163836163837163838163839163840163841163842163843163844163845163846163847163848163849163850163851163852163853163854163855163856163857163858163859163860163861163862163863163864163865163866163867163868163869163870163871163872163873163874163875163876163877163878163879163880163881163882163883163884163885163886163887163888163889163890163891163892163893163894163895163896163897163898163899163900163901163902163903163904163905163906163907163908163909163910163911163912163913163914163915163916163917163918163919163920163921163922163923163924163925163926163927163928163929163930163931163932163933163934163935163936163937163938163939163940163941163942163943163944163945163946163947163948163949163950163951163952163953163954163955163956163957163958163959163960163961163962163963163964163965163966163967163968163969163970163971163972163973163974163975163976163977163978163979163980163981163982163983163984163985163986163987163988163989163990163991163992163993163994163995163996163997163998163999164000164001164002164003164004164005164006164007164008164009164010164011164012164013164014164015164016164017164018164019164020164021164022164023164024164025164026164027164028164029164030164031164032164033164034164035164036164037164038164039164040164041164042164043164044164045164046164047164048164049164050164051164052164053164054164055164056164057164058164059164060164061164062164063164064164065164066164067164068164069164070164071164072164073164074164075164076164077164078164079164080164081164082164083164084164085164086164087164088164089164090164091164092164093164094164095164096164097164098164099164100164101164102164103164104164105164106164107164108164109164110164111164112164113164114164115164116164117164118164119164120164121164122164123164124164125164126164127164128164129164130164131164132164133164134164135164136164137164138164139164140164141164142164143164144164145164146164147164148164149164150164151164152164153164154164155164156164157164158164159164160164161164162164163164164164165164166164167164168164169164170164171164172164173164174164175164176164177164178164179164180164181164182164183164184164185164186164187164188164189164190164191164192164193164194164195164196164197164198164199164200164201164202164203164204164205164206164207164208164209164210164211164212164213164214164215164216164217164218164219164220164221164222164223164224164225164226164227164228164229164230164231164232164233164234164235164236164237164238164239164240164241164242164243164244164245164246164247164248164249164250164251164252164253164254164255164256164257164258164259164260164261164262164263164264164265164266164267164268164269164270164271164272164273164274164275164276164277164278164279164280164281164282164283164284164285164286164287164288164289164290164291164292164293164294164295164296164297164298164299164300164301164302164303164304164305164306164307164308164309164310164311164312164313164314164315164316164317164318164319164320164321164322164323164324164325164326164327164328164329164330164331164332164333164334164335164336164337164338164339164340164341164342164343164344164345164346164347164348164349164350164351164352164353164354164355164356164357164358164359164360164361164362164363164364164365164366164367164368164369164370164371164372164373164374164375164376164377164378164379164380164381164382164383164384164385164386164387164388164389164390164391164392164393164394164395164396164397164398164399164400164401164402164403164404164405164406164407164408164409164410164411164412164413164414164415164416164417164418164419164420164421164422164423164424164425164426164427164428164429164430164431164432164433164434164435164436164437164438164439164440164441164442164443164444164445164446164447164448164449164450164451164452164453164454164455164456164457164458164459164460164461164462164463164464164465164466164467164468164469164470164471164472164473164474164475164476164477164478164479164480164481164482164483164484164485164486164487164488164489164490164491164492164493164494164495164496164497164498164499164500164501164502164503164504164505164506164507164508164509164510164511164512164513164514164515164516164517164518164519164520164521164522164523164524164525164526164527164528164529164530164531164532164533164534164535164536164537164538164539164540164541164542164543164544164545164546164547164548164549164550164551164552164553164554164555164556164557164558164559164560164561164562164563164564164565164566164567164568164569164570164571164572164573164574164575164576164577164578164579164580164581164582164583164584164585164586164587164588164589164590164591164592164593164594164595164596164597164598164599164600164601164602164603164604164605164606164607164608164609164610164611164612164613164614164615164616164617164618164619164620164621164622164623164624164625164626164627164628164629164630164631164632164633164634164635164636164637164638164639164640164641164642164643164644164645164646164647164648164649164650164651164652164653164654164655164656164657164658164659164660164661164662164663164664164665164666164667164668164669164670164671164672164673164674164675164676164677164678164679164680164681164682164683164684164685164686164687164688164689164690164691164692164693164694164695164696164697164698164699164700164701164702164703164704164705164706164707164708164709164710164711164712164713164714164715164716164717164718164719164720164721164722164723164724164725164726164727164728164729164730164731164732164733164734164735164736164737164738164739164740164741164742164743164744164745164746164747164748164749164750164751164752164753164754164755164756164757164758164759164760164761164762164763164764164765164766164767164768164769164770164771164772164773164774164775164776164777164778164779164780164781164782164783164784164785164786164787164788164789164790164791164792164793164794164795164796164797164798164799164800164801164802164803164804164805164806164807164808164809164810164811164812164813164814164815164816164817164818164819164820164821164822164823164824164825164826164827164828164829164830164831164832164833164834164835164836164837164838164839164840164841164842164843164844164845164846164847164848164849164850164851164852164853164854164855164856164857164858164859164860164861164862164863164864164865164866164867164868164869164870164871164872164873164874164875164876164877164878164879164880164881164882164883164884164885164886164887164888164889164890164891164892164893164894164895164896164897164898164899164900164901164902164903164904164905164906164907164908164909164910164911164912164913164914164915164916164917164918164919164920164921164922164923164924164925164926164927164928164929164930164931164932164933164934164935164936164937164938164939164940164941164942164943164944164945164946164947164948164949164950164951164952164953164954164955164956164957164958164959164960164961164962164963164964164965164966164967164968164969164970164971164972164973164974164975164976164977164978164979164980164981164982164983164984164985164986164987164988164989164990164991164992164993164994164995164996164997164998164999165000165001165002165003165004165005165006165007165008165009165010165011165012165013165014165015165016165017165018165019165020165021165022165023165024165025165026165027165028165029165030165031165032165033165034165035165036165037165038165039165040165041165042165043165044165045165046165047165048165049165050165051165052165053165054165055165056165057165058165059165060165061165062165063165064165065165066165067165068165069165070165071165072165073165074165075165076165077165078165079165080165081165082165083165084165085165086165087165088165089165090165091165092165093165094165095165096165097165098165099165100165101165102165103165104165105165106165107165108165109165110165111165112165113165114165115165116165117165118165119165120165121165122165123165124165125165126165127165128165129165130165131165132165133165134165135165136165137165138165139165140165141165142165143165144165145165146165147165148165149165150165151165152165153165154165155165156165157165158165159165160165161165162165163165164165165165166165167165168165169165170165171165172165173165174165175165176165177165178165179165180165181165182165183165184165185165186165187165188165189165190165191165192165193165194165195165196165197165198165199165200165201165202165203165204165205165206165207165208165209165210165211165212165213165214165215165216165217165218165219165220165221165222165223165224165225165226165227165228165229165230165231165232165233165234165235165236165237165238165239165240165241165242165243165244165245165246165247165248165249165250165251165252165253165254165255165256165257165258165259165260165261165262165263165264165265165266165267165268165269165270165271165272165273165274165275165276165277165278165279165280165281165282165283165284165285165286165287165288165289165290165291165292165293165294165295165296165297165298165299165300165301165302165303165304165305165306165307165308165309165310165311165312165313165314165315165316165317165318165319165320165321165322165323165324165325165326165327165328165329165330165331165332165333165334165335165336165337165338165339165340165341165342165343165344165345165346165347165348165349165350165351165352165353165354165355165356165357165358165359165360165361165362165363165364165365165366165367165368165369165370165371165372165373165374165375165376165377165378165379165380165381165382165383165384165385165386165387165388165389165390165391165392165393165394165395165396165397165398165399165400165401165402165403165404165405165406165407165408165409165410165411165412165413165414165415165416165417165418165419165420165421165422165423165424165425165426165427165428165429165430165431165432165433165434165435165436165437165438165439165440165441165442165443165444165445165446165447165448165449165450165451165452165453165454165455165456165457165458165459165460165461165462165463165464165465165466165467165468165469165470165471165472165473165474165475165476165477165478165479165480165481165482165483165484165485165486165487165488165489165490165491165492165493165494165495165496165497165498165499165500165501165502165503165504165505165506165507165508165509165510165511165512165513165514165515165516165517165518165519165520165521165522165523165524165525165526165527165528165529165530165531165532165533165534165535165536165537165538165539165540165541165542165543165544165545165546165547165548165549165550165551165552165553165554165555165556165557165558165559165560165561165562165563165564165565165566165567165568165569165570165571165572165573165574165575165576165577165578165579165580165581165582165583165584165585165586165587165588165589165590165591165592165593165594165595165596165597165598165599165600165601165602165603165604165605165606165607165608165609165610165611165612165613165614165615165616165617165618165619165620165621165622165623165624165625165626165627165628165629165630165631165632165633165634165635165636165637165638165639165640165641165642165643165644165645165646165647165648165649165650165651165652165653165654165655165656165657165658165659165660165661165662165663165664165665165666165667165668165669165670165671165672165673165674165675165676165677165678165679165680165681165682165683165684165685165686165687165688165689165690165691165692165693165694165695165696165697165698165699165700165701165702165703165704165705165706165707165708165709165710165711165712165713165714165715165716165717165718165719165720165721165722165723165724165725165726165727165728165729165730165731165732165733165734165735165736165737165738165739165740165741165742165743165744165745165746165747165748165749165750165751165752165753165754165755165756165757165758165759165760165761165762165763165764165765165766165767165768165769165770165771165772165773165774165775165776165777165778165779165780165781165782165783165784165785165786165787165788165789165790165791165792165793165794165795165796165797165798165799165800165801165802165803165804165805165806165807165808165809165810165811165812165813165814165815165816165817165818165819165820165821165822165823165824165825165826165827165828165829165830165831165832165833165834165835165836165837165838165839165840165841165842165843165844165845165846165847165848165849165850165851165852165853165854165855165856165857165858165859165860165861165862165863165864165865165866165867165868165869165870165871165872165873165874165875165876165877165878165879165880165881165882165883165884165885165886165887165888165889165890165891165892165893165894165895165896165897165898165899165900165901165902165903165904165905165906165907165908165909165910165911165912165913165914165915165916165917165918165919165920165921165922165923165924165925165926165927165928165929165930165931165932165933165934165935165936165937165938165939165940165941165942165943165944165945165946165947165948165949165950165951165952165953165954165955165956165957165958165959165960165961165962165963165964165965165966165967165968165969165970165971165972165973165974165975165976165977165978165979165980165981165982165983165984165985165986165987165988165989165990165991165992165993165994165995165996165997165998165999166000166001166002166003166004166005166006166007166008166009166010166011166012166013166014166015166016166017166018166019166020166021166022166023166024166025166026166027166028166029166030166031166032166033166034166035166036166037166038166039166040166041166042166043166044166045166046166047166048166049166050166051166052166053166054166055166056166057166058166059166060166061166062166063166064166065166066166067166068166069166070166071166072166073166074166075166076166077166078166079166080166081166082166083166084166085166086166087166088166089166090166091166092166093166094166095166096166097166098166099166100166101166102166103166104166105166106166107166108166109166110166111166112166113166114166115166116166117166118166119166120166121166122166123166124166125166126166127166128166129166130166131166132166133166134166135166136166137166138166139166140166141166142166143166144166145166146166147166148166149166150166151166152166153166154166155166156166157166158166159166160166161166162166163166164166165166166166167166168166169166170166171166172166173166174166175166176166177166178166179166180166181166182166183166184166185166186166187166188166189166190166191166192166193166194166195166196166197166198166199166200166201166202166203166204166205166206166207166208166209166210166211166212166213166214166215166216166217166218166219166220166221166222166223166224166225166226166227166228166229166230166231166232166233166234166235166236166237166238166239166240166241166242166243166244166245166246166247166248166249166250166251166252166253166254166255166256166257166258166259166260166261166262166263166264166265166266166267166268166269166270166271166272166273166274166275166276166277166278166279166280166281166282166283166284166285166286166287166288166289166290166291166292166293166294166295166296166297166298166299166300166301166302166303166304166305166306166307166308166309166310166311166312166313166314166315166316166317166318166319166320166321166322166323166324166325166326166327166328166329166330166331166332166333166334166335166336166337166338166339166340166341166342166343166344166345166346166347166348166349166350166351166352166353166354166355166356166357166358166359166360166361166362166363166364166365166366166367166368166369166370166371166372166373166374166375166376166377166378166379166380166381166382166383166384166385166386166387166388166389166390166391166392166393166394166395166396166397166398166399166400166401166402166403166404166405166406166407166408166409166410166411166412166413166414166415166416166417166418166419166420166421166422166423166424166425166426166427166428166429166430166431166432166433166434166435166436166437166438166439166440166441166442166443166444166445166446166447166448166449166450166451166452166453166454166455166456166457166458166459166460166461166462166463166464166465166466166467166468166469166470166471166472166473166474166475166476166477166478166479166480166481166482166483166484166485166486166487166488166489166490166491166492166493166494166495166496166497166498166499166500166501166502166503166504166505166506166507166508166509166510166511166512166513166514166515166516166517166518166519166520166521166522166523166524166525166526166527166528166529166530166531166532166533166534166535166536166537166538166539166540166541166542166543166544166545166546166547166548166549166550166551166552166553166554166555166556166557166558166559166560166561166562166563166564166565166566166567166568166569166570166571166572166573166574166575166576166577166578166579166580166581166582166583166584166585166586166587166588166589166590166591166592166593166594166595166596166597166598166599166600166601166602166603166604166605166606166607166608166609166610166611166612166613166614166615166616166617166618166619166620166621166622166623166624166625166626166627166628166629166630166631166632166633166634166635166636166637166638166639166640166641166642166643166644166645166646166647166648166649166650166651166652166653166654166655166656166657166658166659166660166661166662166663166664166665166666166667166668166669166670166671166672166673166674166675166676166677166678166679166680166681166682166683166684166685166686166687166688166689166690166691166692166693166694166695166696166697166698166699166700166701166702166703166704166705166706166707166708166709166710166711166712166713166714166715166716166717166718166719166720166721166722166723166724166725166726166727166728166729166730166731166732166733166734166735166736166737166738166739166740166741166742166743166744166745166746166747166748166749166750166751166752166753166754166755166756166757166758166759166760166761166762166763166764166765166766166767166768166769166770166771166772166773166774166775166776166777166778166779166780166781166782166783166784166785166786166787166788166789166790166791166792166793166794166795166796166797166798166799166800166801166802166803166804166805166806166807166808166809166810166811166812166813166814166815166816166817166818166819166820166821166822166823166824166825166826166827166828166829166830166831166832166833166834166835166836166837166838166839166840166841166842166843166844166845166846166847166848166849166850166851166852166853166854166855166856166857166858166859166860166861166862166863166864166865166866166867166868166869166870166871166872166873166874166875166876166877166878166879166880166881166882166883166884166885166886166887166888166889166890166891166892166893166894166895166896166897166898166899166900166901166902166903166904166905166906166907166908166909166910166911166912166913166914166915166916166917166918166919166920166921166922166923166924166925166926166927166928166929166930166931166932166933166934166935166936166937166938166939166940166941166942166943166944166945166946166947166948166949166950166951166952166953166954166955166956166957166958166959166960166961166962166963166964166965166966166967166968166969166970166971166972166973166974166975166976166977166978166979166980166981166982166983166984166985166986166987166988166989166990166991166992166993166994166995166996166997166998166999167000167001167002167003167004167005167006167007167008167009167010167011167012167013167014167015167016167017167018167019167020167021167022167023167024167025167026167027167028167029167030167031167032167033167034167035167036167037167038167039167040167041167042167043167044167045167046167047167048167049167050167051167052167053167054167055167056167057167058167059167060167061167062167063167064167065167066167067167068167069167070167071167072167073167074167075167076167077167078167079167080167081167082167083167084167085167086167087167088167089167090167091167092167093167094167095167096167097167098167099167100167101167102167103167104167105167106167107167108167109167110167111167112167113167114167115167116167117167118167119167120167121167122167123167124167125167126167127167128167129167130167131167132167133167134167135167136167137167138167139167140167141167142167143167144167145167146167147167148167149167150167151167152167153167154167155167156167157167158167159167160167161167162167163167164167165167166167167167168167169167170167171167172167173167174167175167176167177167178167179167180167181167182167183167184167185167186167187167188167189167190167191167192167193167194167195167196167197167198167199167200167201167202167203167204167205167206167207167208167209167210167211167212167213167214167215167216167217167218167219167220167221167222167223167224167225167226167227167228167229167230167231167232167233167234167235167236167237167238167239167240167241167242167243167244167245167246167247167248167249167250167251167252167253167254167255167256167257167258167259167260167261167262167263167264167265167266167267167268167269167270167271167272167273167274167275167276167277167278167279167280167281167282167283167284167285167286167287167288167289167290167291167292167293167294167295167296167297167298167299167300167301167302167303167304167305167306167307167308167309167310167311167312167313167314167315167316167317167318167319167320167321167322167323167324167325167326167327167328167329167330167331167332167333167334167335167336167337167338167339167340167341167342167343167344167345167346167347167348167349167350167351167352167353167354167355167356167357167358167359167360167361167362167363167364167365167366167367167368167369167370167371167372167373167374167375167376167377167378167379167380167381167382167383167384167385167386167387167388167389167390167391167392167393167394167395167396167397167398167399167400167401167402167403167404167405167406167407167408167409167410167411167412167413167414167415167416167417167418167419167420167421167422167423167424167425167426167427167428167429167430167431167432167433167434167435167436167437167438167439167440167441167442167443167444167445167446167447167448167449167450167451167452167453167454167455167456167457167458167459167460167461167462167463167464167465167466167467167468167469167470167471167472167473167474167475167476167477167478167479167480167481167482167483167484167485167486167487167488167489167490167491167492167493167494167495167496167497167498167499167500167501167502167503167504167505167506167507167508167509167510167511167512167513167514167515167516167517167518167519167520167521167522167523167524167525167526167527167528167529167530167531167532167533167534167535167536167537167538167539167540167541167542167543167544167545167546167547167548167549167550167551167552167553167554167555167556167557167558167559167560167561167562167563167564167565167566167567167568167569167570167571167572167573167574167575167576167577167578167579167580167581167582167583167584167585167586167587167588167589167590167591167592167593167594167595167596167597167598167599167600167601167602167603167604167605167606167607167608167609167610167611167612167613167614167615167616167617167618167619167620167621167622167623167624167625167626167627167628167629167630167631167632167633167634167635167636167637167638167639167640167641167642167643167644167645167646167647167648167649167650167651167652167653167654167655167656167657167658167659167660167661167662167663167664167665167666167667167668167669167670167671167672167673167674167675167676167677167678167679167680167681167682167683167684167685167686167687167688167689167690167691167692167693167694167695167696167697167698167699167700167701167702167703167704167705167706167707167708167709167710167711167712167713167714167715167716167717167718167719167720167721167722167723167724167725167726167727167728167729167730167731167732167733167734167735167736167737167738167739167740167741167742167743167744167745167746167747167748167749167750167751167752167753167754167755167756167757167758167759167760167761167762167763167764167765167766167767167768167769167770167771167772167773167774167775167776167777167778167779167780167781167782167783167784167785167786167787167788167789167790167791167792167793167794167795167796167797167798167799167800167801167802167803167804167805167806167807167808167809167810167811167812167813167814167815167816167817167818167819167820167821167822167823167824167825167826167827167828167829167830167831167832167833167834167835167836167837167838167839167840167841167842167843167844167845167846167847167848167849167850167851167852167853167854167855167856167857167858167859167860167861167862167863167864167865167866167867167868167869167870167871167872167873167874167875167876167877167878167879167880167881167882167883167884167885167886167887167888167889167890167891167892167893167894167895167896167897167898167899167900167901167902167903167904167905167906167907167908167909167910167911167912167913167914167915167916167917167918167919167920167921167922167923167924167925167926167927167928167929167930167931167932167933167934167935167936167937167938167939167940167941167942167943167944167945167946167947167948167949167950167951167952167953167954167955167956167957167958167959167960167961167962167963167964167965167966167967167968167969167970167971167972167973167974167975167976167977167978167979167980167981167982167983167984167985167986167987167988167989167990167991167992167993167994167995167996167997167998167999168000168001168002168003168004168005168006168007168008168009168010168011168012168013168014168015168016168017168018168019168020168021168022168023168024168025168026168027168028168029168030168031168032168033168034168035168036168037168038168039168040168041168042168043168044168045168046168047168048168049168050168051168052168053168054168055168056168057168058168059168060168061168062168063168064168065168066168067168068168069168070168071168072168073168074168075168076168077168078168079168080168081168082168083168084168085168086168087168088168089168090168091168092168093168094168095168096168097168098168099168100168101168102168103168104168105168106168107168108168109168110168111168112168113168114168115168116168117168118168119168120168121168122168123168124168125168126168127168128168129168130168131168132168133168134168135168136168137168138168139168140168141168142168143168144168145168146168147168148168149168150168151168152168153168154168155168156168157168158168159168160168161168162168163168164168165168166168167168168168169168170168171168172168173168174168175168176168177168178168179168180168181168182168183168184168185168186168187168188168189168190168191168192168193168194168195168196168197168198168199168200168201168202168203168204168205168206168207168208168209168210168211168212168213168214168215168216168217168218168219168220168221168222168223168224168225168226168227168228168229168230168231168232168233168234168235168236168237168238168239168240168241168242168243168244168245168246168247168248168249168250168251168252168253168254168255168256168257168258168259168260168261168262168263168264168265168266168267168268168269168270168271168272168273168274168275168276168277168278168279168280168281168282168283168284168285168286168287168288168289168290168291168292168293168294168295168296168297168298168299168300168301168302168303168304168305168306168307168308168309168310168311168312168313168314168315168316168317168318168319168320168321168322168323168324168325168326168327168328168329168330168331168332168333168334168335168336168337168338168339168340168341168342168343168344168345168346168347168348168349168350168351168352168353168354168355168356168357168358168359168360168361168362168363168364168365168366168367168368168369168370168371168372168373168374168375168376168377168378168379168380168381168382168383168384168385168386168387168388168389168390168391168392168393168394168395168396168397168398168399168400168401168402168403168404168405168406168407168408168409168410168411168412168413168414168415168416168417168418168419168420168421168422168423168424168425168426168427168428168429168430168431168432168433168434168435168436168437168438168439168440168441168442168443168444168445168446168447168448168449168450168451168452168453168454168455168456168457168458168459168460168461168462168463168464168465168466168467168468168469168470168471168472168473168474168475168476168477168478168479168480168481168482168483168484168485168486168487168488168489168490168491168492168493168494168495168496168497168498168499168500168501168502168503168504168505168506168507168508168509168510168511168512168513168514168515168516168517168518168519168520168521168522168523168524168525168526168527168528168529168530168531168532168533168534168535168536168537168538168539168540168541168542168543168544168545168546168547168548168549168550168551168552168553168554168555168556168557168558168559168560168561168562168563168564168565168566168567168568168569168570168571168572168573168574168575168576168577168578168579168580168581168582168583168584168585168586168587168588168589168590168591168592168593168594168595168596168597168598168599168600168601168602168603168604168605168606168607168608168609168610168611168612168613168614168615168616168617168618168619168620168621168622168623168624168625168626168627168628168629168630168631168632168633168634168635168636168637168638168639168640168641168642168643168644168645168646168647168648168649168650168651168652168653168654168655168656168657168658168659168660168661168662168663168664168665168666168667168668168669168670168671168672168673168674168675168676168677168678168679168680168681168682168683168684168685168686168687168688168689168690168691168692168693168694168695168696168697168698168699168700168701168702168703168704168705168706168707168708168709168710168711168712168713168714168715168716168717168718168719168720168721168722168723168724168725168726168727168728168729168730168731168732168733168734168735168736168737168738168739168740168741168742168743168744168745168746168747168748168749168750168751168752168753168754168755168756168757168758168759168760168761168762168763168764168765168766168767168768168769168770168771168772168773168774168775168776168777168778168779168780168781168782168783168784168785168786168787168788168789168790168791168792168793168794168795168796168797168798168799168800168801168802168803168804168805168806168807168808168809168810168811168812168813168814168815168816168817168818168819168820168821168822168823168824168825168826168827168828168829168830168831168832168833168834168835168836168837168838168839168840168841168842168843168844168845168846168847168848168849168850168851168852168853168854168855168856168857168858168859168860168861168862168863168864168865168866168867168868168869168870168871168872168873168874168875168876168877168878168879168880168881168882168883168884168885168886168887168888168889168890168891168892168893168894168895168896168897168898168899168900168901168902168903168904168905168906168907168908168909168910168911168912168913168914168915168916168917168918168919168920168921168922168923168924168925168926168927168928168929168930168931168932168933168934168935168936168937168938168939168940168941168942168943168944168945168946168947168948168949168950168951168952168953168954168955168956168957168958168959168960168961168962168963168964168965168966168967168968168969168970168971168972168973168974168975168976168977168978168979168980168981168982168983168984168985168986168987168988168989168990168991168992168993168994168995168996168997168998168999169000169001169002169003169004169005169006169007169008169009169010169011169012169013169014169015169016169017169018169019169020169021169022169023169024169025169026169027169028169029169030169031169032169033169034169035169036169037169038169039169040169041169042169043169044169045169046169047169048169049169050169051169052169053169054169055169056169057169058169059169060169061169062169063169064169065169066169067169068169069169070169071169072169073169074169075169076169077169078169079169080169081169082169083169084169085169086169087169088169089169090169091169092169093169094169095169096169097169098169099169100169101169102169103169104169105169106169107169108169109169110169111169112169113169114169115169116169117169118169119169120169121169122169123169124169125169126169127169128169129169130169131169132169133169134169135169136169137169138169139169140169141169142169143169144169145169146169147169148169149169150169151169152169153169154169155169156169157169158169159169160169161169162169163169164169165169166169167169168169169169170169171169172169173169174169175169176169177169178169179169180169181169182169183169184169185169186169187169188169189169190169191169192169193169194169195169196169197169198169199169200169201169202169203169204169205169206169207169208169209169210169211169212169213169214169215169216169217169218169219169220169221169222169223169224169225169226169227169228169229169230169231169232169233169234169235169236169237169238169239169240169241169242169243169244169245169246169247169248169249169250169251169252169253169254169255169256169257169258169259169260169261169262169263169264169265169266169267169268169269169270169271169272169273169274169275169276169277169278169279169280169281169282169283169284169285169286169287169288169289169290169291169292169293169294169295169296169297169298169299169300169301169302169303169304169305169306169307169308169309169310169311169312169313169314169315169316169317169318169319169320169321169322169323169324169325169326169327169328169329169330169331169332169333169334169335169336169337169338169339169340169341169342169343169344169345169346169347169348169349169350169351169352169353169354169355169356169357169358169359169360169361169362169363169364169365169366169367169368169369169370169371169372169373169374169375169376169377169378169379169380169381169382169383169384169385169386169387169388169389169390169391169392169393169394169395169396169397169398169399169400169401169402169403169404169405169406169407169408169409169410169411169412169413169414169415169416169417169418169419169420169421169422169423169424169425169426169427169428169429169430169431169432169433169434169435169436169437169438169439169440169441169442169443169444169445169446169447169448169449169450169451169452169453169454169455169456169457169458169459169460169461169462169463169464169465169466169467169468169469169470169471169472169473169474169475169476169477169478169479169480169481169482169483169484169485169486169487169488169489169490169491169492169493169494169495169496169497169498169499169500169501169502169503169504169505169506169507169508169509169510169511169512169513169514169515169516169517169518169519169520169521169522169523169524169525169526169527169528169529169530169531169532169533169534169535169536169537169538169539169540169541169542169543169544169545169546169547169548169549169550169551169552169553169554169555169556169557169558169559169560169561169562169563169564169565169566169567169568169569169570169571169572169573169574169575169576169577169578169579169580169581169582169583169584169585169586169587169588169589169590169591169592169593169594169595169596169597169598169599169600169601169602169603169604169605169606169607169608169609169610169611169612169613169614169615169616169617169618169619169620169621169622169623169624169625169626169627169628169629169630169631169632169633169634169635169636169637169638169639169640169641169642169643169644169645169646169647169648169649169650169651169652169653169654169655169656169657169658169659169660169661169662169663169664169665169666169667169668169669169670169671169672169673169674169675169676169677169678169679169680169681169682169683169684169685169686169687169688169689169690169691169692169693169694169695169696169697169698169699169700169701169702169703169704169705169706169707169708169709169710169711169712169713169714169715169716169717169718169719169720169721169722169723169724169725169726169727169728169729169730169731169732169733169734169735169736169737169738169739169740169741169742169743169744169745169746169747169748169749169750169751169752169753169754169755169756169757169758169759169760169761169762169763169764169765169766169767169768169769169770169771169772169773169774169775169776169777169778169779169780169781169782169783169784169785169786169787169788169789169790169791169792169793169794169795169796169797169798169799169800169801169802169803169804169805169806169807169808169809169810169811169812169813169814169815169816169817169818169819169820169821169822169823169824169825169826169827169828169829169830169831169832169833169834169835169836169837169838169839169840169841169842169843169844169845169846169847169848169849169850169851169852169853169854169855169856169857169858169859169860169861169862169863169864169865169866169867169868169869169870169871169872169873169874169875169876169877169878169879169880169881169882169883169884169885169886169887169888169889169890169891169892169893169894169895169896169897169898169899169900169901169902169903169904169905169906169907169908169909169910169911169912169913169914169915169916169917169918169919169920169921169922169923169924169925169926169927169928169929169930169931169932169933169934169935169936169937169938169939169940169941169942169943169944169945169946169947169948169949169950169951169952169953169954169955169956169957169958169959169960169961169962169963169964169965169966169967169968169969169970169971169972169973169974169975169976169977169978169979169980169981169982169983169984169985169986169987169988169989169990169991169992169993169994169995169996169997169998169999170000170001170002170003170004170005170006170007170008170009170010170011170012170013170014170015170016170017170018170019170020170021170022170023170024170025170026170027170028170029170030170031170032170033170034170035170036170037170038170039170040170041170042170043170044170045170046170047170048170049170050170051170052170053170054170055170056170057170058170059170060170061170062170063170064170065170066170067170068170069170070170071170072170073170074170075170076170077170078170079170080170081170082170083170084170085170086170087170088170089170090170091170092170093170094170095170096170097170098170099170100170101170102170103170104170105170106170107170108170109170110170111170112170113170114170115170116170117170118170119170120170121170122170123170124170125170126170127170128170129170130170131170132170133170134170135170136170137170138170139170140170141170142170143170144170145170146170147170148170149170150170151170152170153170154170155170156170157170158170159170160170161170162170163170164170165170166170167170168170169170170170171170172170173170174170175170176170177170178170179170180170181170182170183170184170185170186170187170188170189170190170191170192170193170194170195170196170197170198170199170200170201170202170203170204170205170206170207170208170209170210170211170212170213170214170215170216170217170218170219170220170221170222170223170224170225170226170227170228170229170230170231170232170233170234170235170236170237170238170239170240170241170242170243170244170245170246170247170248170249170250170251170252170253170254170255170256170257170258170259170260170261170262170263170264170265170266170267170268170269170270170271170272170273170274170275170276170277170278170279170280170281170282170283170284170285170286170287170288170289170290170291170292170293170294170295170296170297170298170299170300170301170302170303170304170305170306170307170308170309170310170311170312170313170314170315170316170317170318170319170320170321170322170323170324170325170326170327170328170329170330170331170332170333170334170335170336170337170338170339170340170341170342170343170344170345170346170347170348170349170350170351170352170353170354170355170356170357170358170359170360170361170362170363170364170365170366170367170368170369170370170371170372170373170374170375170376170377170378170379170380170381170382170383170384170385170386170387170388170389170390170391170392170393170394170395170396170397170398170399170400170401170402170403170404170405170406170407170408170409170410170411170412170413170414170415170416170417170418170419170420170421170422170423170424170425170426170427170428170429170430170431170432170433170434170435170436170437170438170439170440170441170442170443170444170445170446170447170448170449170450170451170452170453170454170455170456170457170458170459170460170461170462170463170464170465170466170467170468170469170470170471170472170473170474170475170476170477170478170479170480170481170482170483170484170485170486170487170488170489170490170491170492170493170494170495170496170497170498170499170500170501170502170503170504170505170506170507170508170509170510170511170512170513170514170515170516170517170518170519170520170521170522170523170524170525170526170527170528170529170530170531170532170533170534170535170536170537170538170539170540170541170542170543170544170545170546170547170548170549170550170551170552170553170554170555170556170557170558170559170560170561170562170563170564170565170566170567170568170569170570170571170572170573170574170575170576170577170578170579170580170581170582170583170584170585170586170587170588170589170590170591170592170593170594170595170596170597170598170599170600170601170602170603170604170605170606170607170608170609170610170611170612170613170614170615170616170617170618170619170620170621170622170623170624170625170626170627170628170629170630170631170632170633170634170635170636170637170638170639170640170641170642170643170644170645170646170647170648170649170650170651170652170653170654170655170656170657170658170659170660170661170662170663170664170665170666170667170668170669170670170671170672170673170674170675170676170677170678170679170680170681170682170683170684170685170686170687170688170689170690170691170692170693170694170695170696170697170698170699170700170701170702170703170704170705170706170707170708170709170710170711170712170713170714170715170716170717170718170719170720170721170722170723170724170725170726170727170728170729170730170731170732170733170734170735170736170737170738170739170740170741170742170743170744170745170746170747170748170749170750170751170752170753170754170755170756170757170758170759170760170761170762170763170764170765170766170767170768170769170770170771170772170773170774170775170776170777170778170779170780170781170782170783170784170785170786170787170788170789170790170791170792170793170794170795170796170797170798170799170800170801170802170803170804170805170806170807170808170809170810170811170812170813170814170815170816170817170818170819170820170821170822170823170824170825170826170827170828170829170830170831170832170833170834170835170836170837170838170839170840170841170842170843170844170845170846170847170848170849170850170851170852170853170854170855170856170857170858170859170860170861170862170863170864170865170866170867170868170869170870170871170872170873170874170875170876170877170878170879170880170881170882170883170884170885170886170887170888170889170890170891170892170893170894170895170896170897170898170899170900170901170902170903170904170905170906170907170908170909170910170911170912170913170914170915170916170917170918170919170920170921170922170923170924170925170926170927170928170929170930170931170932170933170934170935170936170937170938170939170940170941170942170943170944170945170946170947170948170949170950170951170952170953170954170955170956170957170958170959170960170961170962170963170964170965170966170967170968170969170970170971170972170973170974170975170976170977170978170979170980170981170982170983170984170985170986170987170988170989170990170991170992170993170994170995170996170997170998170999171000171001171002171003171004171005171006171007171008171009171010171011171012171013171014171015171016171017171018171019171020171021171022171023171024171025171026171027171028171029171030171031171032171033171034171035171036171037171038171039171040171041171042171043171044171045171046171047171048171049171050171051171052171053171054171055171056171057171058171059171060171061171062171063171064171065171066171067171068171069171070171071171072171073171074171075171076171077171078171079171080171081171082171083171084171085171086171087171088171089171090171091171092171093171094171095171096171097171098171099171100171101171102171103171104171105171106171107171108171109171110171111171112171113171114171115171116171117171118171119171120171121171122171123171124171125171126171127171128171129171130171131171132171133171134171135171136171137171138171139171140171141171142171143171144171145171146171147171148171149171150171151171152171153171154171155171156171157171158171159171160171161171162171163171164171165171166171167171168171169171170171171171172171173171174171175171176171177171178171179171180171181171182171183171184171185171186171187171188171189171190171191171192171193171194171195171196171197171198171199171200171201171202171203171204171205171206171207171208171209171210171211171212171213171214171215171216171217171218171219171220171221171222171223171224171225171226171227171228171229171230171231171232171233171234171235171236171237171238171239171240171241171242171243171244171245171246171247171248171249171250171251171252171253171254171255171256171257171258171259171260171261171262171263171264171265171266171267171268171269171270171271171272171273171274171275171276171277171278171279171280171281171282171283171284171285171286171287171288171289171290171291171292171293171294171295171296171297171298171299171300171301171302171303171304171305171306171307171308171309171310171311171312171313171314171315171316171317171318171319171320171321171322171323171324171325171326171327171328171329171330171331171332171333171334171335171336171337171338171339171340171341171342171343171344171345171346171347171348171349171350171351171352171353171354171355171356171357171358171359171360171361171362171363171364171365171366171367171368171369171370171371171372171373171374171375171376171377171378171379171380171381171382171383171384171385171386171387171388171389171390171391171392171393171394171395171396171397171398171399171400171401171402171403171404171405171406171407171408171409171410171411171412171413171414171415171416171417171418171419171420171421171422171423171424171425171426171427171428171429171430171431171432171433171434171435171436171437171438171439171440171441171442171443171444171445171446171447171448171449171450171451171452171453171454171455171456171457171458171459171460171461171462171463171464171465171466171467171468171469171470171471171472171473171474171475171476171477171478171479171480171481171482171483171484171485171486171487171488171489171490171491171492171493171494171495171496171497171498171499171500171501171502171503171504171505171506171507171508171509171510171511171512171513171514171515171516171517171518171519171520171521171522171523171524171525171526171527171528171529171530171531171532171533171534171535171536171537171538171539171540171541171542171543171544171545171546171547171548171549171550171551171552171553171554171555171556171557171558171559171560171561171562171563171564171565171566171567171568171569171570171571171572171573171574171575171576171577171578171579171580171581171582171583171584171585171586171587171588171589171590171591171592171593171594171595171596171597171598171599171600171601171602171603171604171605171606171607171608171609171610171611171612171613171614171615171616171617171618171619171620171621171622171623171624171625171626171627171628171629171630171631171632171633171634171635171636171637171638171639171640171641171642171643171644171645171646171647171648171649171650171651171652171653171654171655171656171657171658171659171660171661171662171663171664171665171666171667171668171669171670171671171672171673171674171675171676171677171678171679171680171681171682171683171684171685171686171687171688171689171690171691171692171693171694171695171696171697171698171699171700171701171702171703171704171705171706171707171708171709171710171711171712171713171714171715171716171717171718171719171720171721171722171723171724171725171726171727171728171729171730171731171732171733171734171735171736171737171738171739171740171741171742171743171744171745171746171747171748171749171750171751171752171753171754171755171756171757171758171759171760171761171762171763171764171765171766171767171768171769171770171771171772171773171774171775171776171777171778171779171780171781171782171783171784171785171786171787171788171789171790171791171792171793171794171795171796171797171798171799171800171801171802171803171804171805171806171807171808171809171810171811171812171813171814171815171816171817171818171819171820171821171822171823171824171825171826171827171828171829171830171831171832171833171834171835171836171837171838171839171840171841171842171843171844171845171846171847171848171849171850171851171852171853171854171855171856171857171858171859171860171861171862171863171864171865171866171867171868171869171870171871171872171873171874171875171876171877171878171879171880171881171882171883171884171885171886171887171888171889171890171891171892171893171894171895171896171897171898171899171900171901171902171903171904171905171906171907171908171909171910171911171912171913171914171915171916171917171918171919171920171921171922171923171924171925171926171927171928171929171930171931171932171933171934171935171936171937171938171939171940171941171942171943171944171945171946171947171948171949171950171951171952171953171954171955171956171957171958171959171960171961171962171963171964171965171966171967171968171969171970171971171972171973171974171975171976171977171978171979171980171981171982171983171984171985171986171987171988171989171990171991171992171993171994171995171996171997171998171999172000172001172002172003172004172005172006172007172008172009172010172011172012172013172014172015172016172017172018172019172020172021172022172023172024172025172026172027172028172029172030172031172032172033172034172035172036172037172038172039172040172041172042172043172044172045172046172047172048172049172050172051172052172053172054172055172056172057172058172059172060172061172062172063172064172065172066172067172068172069172070172071172072172073172074172075172076172077172078172079172080172081172082172083172084172085172086172087172088172089172090172091172092172093172094172095172096172097172098172099172100172101172102172103172104172105172106172107172108172109172110172111172112172113172114172115172116172117172118172119172120172121172122172123172124172125172126172127172128172129172130172131172132172133172134172135172136172137172138172139172140172141172142172143172144172145172146172147172148172149172150172151172152172153172154172155172156172157172158172159172160172161172162172163172164172165172166172167172168172169172170172171172172172173172174172175172176172177172178172179172180172181172182172183172184172185172186172187172188172189172190172191172192172193172194172195172196172197172198172199172200172201172202172203172204172205172206172207172208172209172210172211172212172213172214172215172216172217172218172219172220172221172222172223172224172225172226172227172228172229172230172231172232172233172234172235172236172237172238172239172240172241172242172243172244172245172246172247172248172249172250172251172252172253172254172255172256172257172258172259172260172261172262172263172264172265172266172267172268172269172270172271172272172273172274172275172276172277172278172279172280172281172282172283172284172285172286172287172288172289172290172291172292172293172294172295172296172297172298172299172300172301172302172303172304172305172306172307172308172309172310172311172312172313172314172315172316172317172318172319172320172321172322172323172324172325172326172327172328172329172330172331172332172333172334172335172336172337172338172339172340172341172342172343172344172345172346172347172348172349172350172351172352172353172354172355172356172357172358172359172360172361172362172363172364172365172366172367172368172369172370172371172372172373172374172375172376172377172378172379172380172381172382172383172384172385172386172387172388172389172390172391172392172393172394172395172396172397172398172399172400172401172402172403172404172405172406172407172408172409172410172411172412172413172414172415172416172417172418172419172420172421172422172423172424172425172426172427172428172429172430172431172432172433172434172435172436172437172438172439172440172441172442172443172444172445172446172447172448172449172450172451172452172453172454172455172456172457172458172459172460172461172462172463172464172465172466172467172468172469172470172471172472172473172474172475172476172477172478172479172480172481172482172483172484172485172486172487172488172489172490172491172492172493172494172495172496172497172498172499172500172501172502172503172504172505172506172507172508172509172510172511172512172513172514172515172516172517172518172519172520172521172522172523172524172525172526172527172528172529172530172531172532172533172534172535172536172537172538172539172540172541172542172543172544172545172546172547172548172549172550172551172552172553172554172555172556172557172558172559172560172561172562172563172564172565172566172567172568172569172570172571172572172573172574172575172576172577172578172579172580172581172582172583172584172585172586172587172588172589172590172591172592172593172594172595172596172597172598172599172600172601172602172603172604172605172606172607172608172609172610172611172612172613172614172615172616172617172618172619172620172621172622172623172624172625172626172627172628172629172630172631172632172633172634172635172636172637172638172639172640172641172642172643172644172645172646172647172648172649172650172651172652172653172654172655172656172657172658172659172660172661172662172663172664172665172666172667172668172669172670172671172672172673172674172675172676172677172678172679172680172681172682172683172684172685172686172687172688172689172690172691172692172693172694172695172696172697172698172699172700172701172702172703172704172705172706172707172708172709172710172711172712172713172714172715172716172717172718172719172720172721172722172723172724172725172726172727172728172729172730172731172732172733172734172735172736172737172738172739172740172741172742172743172744172745172746172747172748172749172750172751172752172753172754172755172756172757172758172759172760172761172762172763172764172765172766172767172768172769172770172771172772172773172774172775172776172777172778172779172780172781172782172783172784172785172786172787172788172789172790172791172792172793172794172795172796172797172798172799172800172801172802172803172804172805172806172807172808172809172810172811172812172813172814172815172816172817172818172819172820172821172822172823172824172825172826172827172828172829172830172831172832172833172834172835172836172837172838172839172840172841172842172843172844172845172846172847172848172849172850172851172852172853172854172855172856172857172858172859172860172861172862172863172864172865172866172867172868172869172870172871172872172873172874172875172876172877172878172879172880172881172882172883172884172885172886172887172888172889172890172891172892172893172894172895172896172897172898172899172900172901172902172903172904172905172906172907172908172909172910172911172912172913172914172915172916172917172918172919172920172921172922172923172924172925172926172927172928172929172930172931172932172933172934172935172936172937172938172939172940172941172942172943172944172945172946172947172948172949172950172951172952172953172954172955172956172957172958172959172960172961172962172963172964172965172966172967172968172969172970172971172972172973172974172975172976172977172978172979172980172981172982172983172984172985172986172987172988172989172990172991172992172993172994172995172996172997172998172999173000173001173002173003173004173005173006173007173008173009173010173011173012173013173014173015173016173017173018173019173020173021173022173023173024173025173026173027173028173029173030173031173032173033173034173035173036173037173038173039173040173041173042173043173044173045173046173047173048173049173050173051173052173053173054173055173056173057173058173059173060173061173062173063173064173065173066173067173068173069173070173071173072173073173074173075173076173077173078173079173080173081173082173083173084173085173086173087173088173089173090173091173092173093173094173095173096173097173098173099173100173101173102173103173104173105173106173107173108173109173110173111173112173113173114173115173116173117173118173119173120173121173122173123173124173125173126173127173128173129173130173131173132173133173134173135173136173137173138173139173140173141173142173143173144173145173146173147173148173149173150173151173152173153173154173155173156173157173158173159173160173161173162173163173164173165173166173167173168173169173170173171173172173173173174173175173176173177173178173179173180173181173182173183173184173185173186173187173188173189173190173191173192173193173194173195173196173197173198173199173200173201173202173203173204173205173206173207173208173209173210173211173212173213173214173215173216173217173218173219173220173221173222173223173224173225173226173227173228173229173230173231173232173233173234173235173236173237173238173239173240173241173242173243173244173245173246173247173248173249173250173251173252173253173254173255173256173257173258173259173260173261173262173263173264173265173266173267173268173269173270173271173272173273173274173275173276173277173278173279173280173281173282173283173284173285173286173287173288173289173290173291173292173293173294173295173296173297173298173299173300173301173302173303173304173305173306173307173308173309173310173311173312173313173314173315173316173317173318173319173320173321173322173323173324173325173326173327173328173329173330173331173332173333173334173335173336173337173338173339173340173341173342173343173344173345173346173347173348173349173350173351173352173353173354173355173356173357173358173359173360173361173362173363173364173365173366173367173368173369173370173371173372173373173374173375173376173377173378173379173380173381173382173383173384173385173386173387173388173389173390173391173392173393173394173395173396173397173398173399173400173401173402173403173404173405173406173407173408173409173410173411173412173413173414173415173416173417173418173419173420173421173422173423173424173425173426173427173428173429173430173431173432173433173434173435173436173437173438173439173440173441173442173443173444173445173446173447173448173449173450173451173452173453173454173455173456173457173458173459173460173461173462173463173464173465173466173467173468173469173470173471173472173473173474173475173476173477173478173479173480173481173482173483173484173485173486173487173488173489173490173491173492173493173494173495173496173497173498173499173500173501173502173503173504173505173506173507173508173509173510173511173512173513173514173515173516173517173518173519173520173521173522173523173524173525173526173527173528173529173530173531173532173533173534173535173536173537173538173539173540173541173542173543173544173545173546173547173548173549173550173551173552173553173554173555173556173557173558173559173560173561173562173563173564173565173566173567173568173569173570173571173572173573173574173575173576173577173578173579173580173581173582173583173584173585173586173587173588173589173590173591173592173593173594173595173596173597173598173599173600173601173602173603173604173605173606173607173608173609173610173611173612173613173614173615173616173617173618173619173620173621173622173623173624173625173626173627173628173629173630173631173632173633173634173635173636173637173638173639173640173641173642173643173644173645173646173647173648173649173650173651173652173653173654173655173656173657173658173659173660173661173662173663173664173665173666173667173668173669173670173671173672173673173674173675173676173677173678173679173680173681173682173683173684173685173686173687173688173689173690173691173692173693173694173695173696173697173698173699173700173701173702173703173704173705173706173707173708173709173710173711173712173713173714173715173716173717173718173719173720173721173722173723173724173725173726173727173728173729173730173731173732173733173734173735173736173737173738173739173740173741173742173743173744173745173746173747173748173749173750173751173752173753173754173755173756173757173758173759173760173761173762173763173764173765173766173767173768173769173770173771173772173773173774173775173776173777173778173779173780173781173782173783173784173785173786173787173788173789173790173791173792173793173794173795173796173797173798173799173800173801173802173803173804173805173806173807173808173809173810173811173812173813173814173815173816173817173818173819173820173821173822173823173824173825173826173827173828173829173830173831173832173833173834173835173836173837173838173839173840173841173842173843173844173845173846173847173848173849173850173851173852173853173854173855173856173857173858173859173860173861173862173863173864173865173866173867173868173869173870173871173872173873173874173875173876173877173878173879173880173881173882173883173884173885173886173887173888173889173890173891173892173893173894173895173896173897173898173899173900173901173902173903173904173905173906173907173908173909173910173911173912173913173914173915173916173917173918173919173920173921173922173923173924173925173926173927173928173929173930173931173932173933173934173935173936173937173938173939173940173941173942173943173944173945173946173947173948173949173950173951173952173953173954173955173956173957173958173959173960173961173962173963173964173965173966173967173968173969173970173971173972173973173974173975173976173977173978173979173980173981173982173983173984173985173986173987173988173989173990173991173992173993173994173995173996173997173998173999174000174001174002174003174004174005174006174007174008174009174010174011174012174013174014174015174016174017174018174019174020174021174022174023174024174025174026174027174028174029174030174031174032174033174034174035174036174037174038174039174040174041174042174043174044174045174046174047174048174049174050174051174052174053174054174055174056174057174058174059174060174061174062174063174064174065174066174067174068174069174070174071174072174073174074174075174076174077174078174079174080174081174082174083174084174085174086174087174088174089174090174091174092174093174094174095174096174097174098174099174100174101174102174103174104174105174106174107174108174109174110174111174112174113174114174115174116174117174118174119174120174121174122174123174124174125174126174127174128174129174130174131174132174133174134174135174136174137174138174139174140174141174142174143174144174145174146174147174148174149174150174151174152174153174154174155174156174157174158174159174160174161174162174163174164174165174166174167174168174169174170174171174172174173174174174175174176174177174178174179174180174181174182174183174184174185174186174187174188174189174190174191174192174193174194174195174196174197174198174199174200174201174202174203174204174205174206174207174208174209174210174211174212174213174214174215174216174217174218174219174220174221174222174223174224174225174226174227174228174229174230174231174232174233174234174235174236174237174238174239174240174241174242174243174244174245174246174247174248174249174250174251174252174253174254174255174256174257174258174259174260174261174262174263174264174265174266174267174268174269174270174271174272174273174274174275174276174277174278174279174280174281174282174283174284174285174286174287174288174289174290174291174292174293174294174295174296174297174298174299174300174301174302174303174304174305174306174307174308174309174310174311174312174313174314174315174316174317174318174319174320174321174322174323174324174325174326174327174328174329174330174331174332174333174334174335174336174337174338174339174340174341174342174343174344174345174346174347174348174349174350174351174352174353174354174355174356174357174358174359174360174361174362174363174364174365174366174367174368174369174370174371174372174373174374174375174376174377174378174379174380174381174382174383174384174385174386174387174388174389174390174391174392174393174394174395174396174397174398174399174400174401174402174403174404174405174406174407174408174409174410174411174412174413174414174415174416174417174418174419174420174421174422174423174424174425174426174427174428174429174430174431174432174433174434174435174436174437174438174439174440174441174442174443174444174445174446174447174448174449174450174451174452174453174454174455174456174457174458174459174460174461174462174463174464174465174466174467174468174469174470174471174472174473174474174475174476174477174478174479174480174481174482174483174484174485174486174487174488174489174490174491174492174493174494174495174496174497174498174499174500174501174502174503174504174505174506174507174508174509174510174511174512174513174514174515174516174517174518174519174520174521174522174523174524174525174526174527174528174529174530174531174532174533174534174535174536174537174538174539174540174541174542174543174544174545174546174547174548174549174550174551174552174553174554174555174556174557174558174559174560174561174562174563174564174565174566174567174568174569174570174571174572174573174574174575174576174577174578174579174580174581174582174583174584174585174586174587174588174589174590174591174592174593174594174595174596174597174598174599174600174601174602174603174604174605174606174607174608174609174610174611174612174613174614174615174616174617174618174619174620174621174622174623174624174625174626174627174628174629174630174631174632174633174634174635174636174637174638174639174640174641174642174643174644174645174646174647174648174649174650174651174652174653174654174655174656174657174658174659174660174661174662174663174664174665174666174667174668174669174670174671174672174673174674174675174676174677174678174679174680174681174682174683174684174685174686174687174688174689174690174691174692174693174694174695174696174697174698174699174700174701174702174703174704174705174706174707174708174709174710174711174712174713174714174715174716174717174718174719174720174721174722174723174724174725174726174727174728174729174730174731174732174733174734174735174736174737174738174739174740174741174742174743174744174745174746174747174748174749174750174751174752174753174754174755174756174757174758174759174760174761174762174763174764174765174766174767174768174769174770174771174772174773174774174775174776174777174778174779174780174781174782174783174784174785174786174787174788174789174790174791174792174793174794174795174796174797174798174799174800174801174802174803174804174805174806174807174808174809174810174811174812174813174814174815174816174817174818174819174820174821174822174823174824174825174826174827174828174829174830174831174832174833174834174835174836174837174838174839174840174841174842174843174844174845174846174847174848174849174850174851174852174853174854174855174856174857174858174859174860174861174862174863174864174865174866174867174868174869174870174871174872174873174874174875174876174877174878174879174880174881174882174883174884174885174886174887174888174889174890174891174892174893174894174895174896174897174898174899174900174901174902174903174904174905174906174907174908174909174910174911174912174913174914174915174916174917174918174919174920174921174922174923174924174925174926174927174928174929174930174931174932174933174934174935174936174937174938174939174940174941174942174943174944174945174946174947174948174949174950174951174952174953174954174955174956174957174958174959174960174961174962174963174964174965174966174967174968174969174970174971174972174973174974174975174976174977174978174979174980174981174982174983174984174985174986174987174988174989174990174991174992174993174994174995174996174997174998174999175000175001175002175003175004175005175006175007175008175009175010175011175012175013175014175015175016175017175018175019175020175021175022175023175024175025175026175027175028175029175030175031175032175033175034175035175036175037175038175039175040175041175042175043175044175045175046175047175048175049175050175051175052175053175054175055175056175057175058175059175060175061175062175063175064175065175066175067175068175069175070175071175072175073175074175075175076175077175078175079175080175081175082175083175084175085175086175087175088175089175090175091175092175093175094175095175096175097175098175099175100175101175102175103175104175105175106175107175108175109175110175111175112175113175114175115175116175117175118175119175120175121175122175123175124175125175126175127175128175129175130175131175132175133175134175135175136175137175138175139175140175141175142175143175144175145175146175147175148175149175150175151175152175153175154175155175156175157175158175159175160175161175162175163175164175165175166175167175168175169175170175171175172175173175174175175175176175177175178175179175180175181175182175183175184175185175186175187175188175189175190175191175192175193175194175195175196175197175198175199175200175201175202175203175204175205175206175207175208175209175210175211175212175213175214175215175216175217175218175219175220175221175222175223175224175225175226175227175228175229175230175231175232175233175234175235175236175237175238175239175240175241175242175243175244175245175246175247175248175249175250175251175252175253175254175255175256175257175258175259175260175261175262175263175264175265175266175267175268175269175270175271175272175273175274175275175276175277175278175279175280175281175282175283175284175285175286175287175288175289175290175291175292175293175294175295175296175297175298175299175300175301175302175303175304175305175306175307175308175309175310175311175312175313175314175315175316175317175318175319175320175321175322175323175324175325175326175327175328175329175330175331175332175333175334175335175336175337175338175339175340175341175342175343175344175345175346175347175348175349175350175351175352175353175354175355175356175357175358175359175360175361175362175363175364175365175366175367175368175369175370175371175372175373175374175375175376175377175378175379175380175381175382175383175384175385175386175387175388175389175390175391175392175393175394175395175396175397175398175399175400175401175402175403175404175405175406175407175408175409175410175411175412175413175414175415175416175417175418175419175420175421175422175423175424175425175426175427175428175429175430175431175432175433175434175435175436175437175438175439175440175441175442175443175444175445175446175447175448175449175450175451175452175453175454175455175456175457175458175459175460175461175462175463175464175465175466175467175468175469175470175471175472175473175474175475175476175477175478175479175480175481175482175483175484175485175486175487175488175489175490175491175492175493175494175495175496175497175498175499175500175501175502175503175504175505175506175507175508175509175510175511175512175513175514175515175516175517175518175519175520175521175522175523175524175525175526175527175528175529175530175531175532175533175534175535175536175537175538175539175540175541175542175543175544175545175546175547175548175549175550175551175552175553175554175555175556175557175558175559175560175561175562175563175564175565175566175567175568175569175570175571175572175573175574175575175576175577175578175579175580175581175582175583175584175585175586175587175588175589175590175591175592175593175594175595175596175597175598175599175600175601175602175603175604175605175606175607175608175609175610175611175612175613175614175615175616175617175618175619175620175621175622175623175624175625175626175627175628175629175630175631175632175633175634175635175636175637175638175639175640175641175642175643175644175645175646175647175648175649175650175651175652175653175654175655175656175657175658175659175660175661175662175663175664175665175666175667175668175669175670175671175672175673175674175675175676175677175678175679175680175681175682175683175684175685175686175687175688175689175690175691175692175693175694175695175696175697175698175699175700175701175702175703175704175705175706175707175708175709175710175711175712175713175714175715175716175717175718175719175720175721175722175723175724175725175726175727175728175729175730175731175732175733175734175735175736175737175738175739175740175741175742175743175744175745175746175747175748175749175750175751175752175753175754175755175756175757175758175759175760175761175762175763175764175765175766175767175768175769175770175771175772175773175774175775175776175777175778175779175780175781175782175783175784175785175786175787175788175789175790175791175792175793175794175795175796175797175798175799175800175801175802175803175804175805175806175807175808175809175810175811175812175813175814175815175816175817175818175819175820175821175822175823175824175825175826175827175828175829175830175831175832175833175834175835175836175837175838175839175840175841175842175843175844175845175846175847175848175849175850175851175852175853175854175855175856175857175858175859175860175861175862175863175864175865175866175867175868175869175870175871175872175873175874175875175876175877175878175879175880175881175882175883175884175885175886175887175888175889175890175891175892175893175894175895175896175897175898175899175900175901175902175903175904175905175906175907175908175909175910175911175912175913175914175915175916175917175918175919175920175921175922175923175924175925175926175927175928175929175930175931175932175933175934175935175936175937175938175939175940175941175942175943175944175945175946175947175948175949175950175951175952175953175954175955175956175957175958175959175960175961175962175963175964175965175966175967175968175969175970175971175972175973175974175975175976175977175978175979175980175981175982175983175984175985175986175987175988175989175990175991175992175993175994175995175996175997175998175999176000176001176002176003176004176005176006176007176008176009176010176011176012176013176014176015176016176017176018176019176020176021176022176023176024176025176026176027176028176029176030176031176032176033176034176035176036176037176038176039176040176041176042176043176044176045176046176047176048176049176050176051176052176053176054176055176056176057176058176059176060176061176062176063176064176065176066176067176068176069176070176071176072176073176074176075176076176077176078176079176080176081176082176083176084176085176086176087176088176089176090176091176092176093176094176095176096176097176098176099176100176101176102176103176104176105176106176107176108176109176110176111176112176113176114176115176116176117176118176119176120176121176122176123176124176125176126176127176128176129176130176131176132176133176134176135176136176137176138176139176140176141176142176143176144176145176146176147176148176149176150176151176152176153176154176155176156176157176158176159176160176161176162176163176164176165176166176167176168176169176170176171176172176173176174176175176176176177176178176179176180176181176182176183176184176185176186176187176188176189176190176191176192176193176194176195176196176197176198176199176200176201176202176203176204176205176206176207176208176209176210176211176212176213176214176215176216176217176218176219176220176221176222176223176224176225176226176227176228176229176230176231176232176233176234176235176236176237176238176239176240176241176242176243176244176245176246176247176248176249176250176251176252176253176254176255176256176257176258176259176260176261176262176263176264176265176266176267176268176269176270176271176272176273176274176275176276176277176278176279176280176281176282176283176284176285176286176287176288176289176290176291176292176293176294176295176296176297176298176299176300176301176302176303176304176305176306176307176308176309176310176311176312176313176314176315176316176317176318176319176320176321176322176323176324176325176326176327176328176329176330176331176332176333176334176335176336176337176338176339176340176341176342176343176344176345176346176347176348176349176350176351176352176353176354176355176356176357176358176359176360176361176362176363176364176365176366176367176368176369176370176371176372176373176374176375176376176377176378176379176380176381176382176383176384176385176386176387176388176389176390176391176392176393176394176395176396176397176398176399176400176401176402176403176404176405176406176407176408176409176410176411176412176413176414176415176416176417176418176419176420176421176422176423176424176425176426176427176428176429176430176431176432176433176434176435176436176437176438176439176440176441176442176443176444176445176446176447176448176449176450176451176452176453176454176455176456176457176458176459176460176461176462176463176464176465176466176467176468176469176470176471176472176473176474176475176476176477176478176479176480176481176482176483176484176485176486176487176488176489176490176491176492176493176494176495176496176497176498176499176500176501176502176503176504176505176506176507176508176509176510176511176512176513176514176515176516176517176518176519176520176521176522176523176524176525176526176527176528176529176530176531176532176533176534176535176536176537176538176539176540176541176542176543176544176545176546176547176548176549176550176551176552176553176554176555176556176557176558176559176560176561176562176563176564176565176566176567176568176569176570176571176572176573176574176575176576176577176578176579176580176581176582176583176584176585176586176587176588176589176590176591176592176593176594176595176596176597176598176599176600176601176602176603176604176605176606176607176608176609176610176611176612176613176614176615176616176617176618176619176620176621176622176623176624176625176626176627176628176629176630176631176632176633176634176635176636176637176638176639176640176641176642176643176644176645176646176647176648176649176650176651176652176653176654176655176656176657176658176659176660176661176662176663176664176665176666176667176668176669176670176671176672176673176674176675176676176677176678176679176680176681176682176683176684176685176686176687176688176689176690176691176692176693176694176695176696176697176698176699176700176701176702176703176704176705176706176707176708176709176710176711176712176713176714176715176716176717176718176719176720176721176722176723176724176725176726176727176728176729176730176731176732176733176734176735176736176737176738176739176740176741176742176743176744176745176746176747176748176749176750176751176752176753176754176755176756176757176758176759176760176761176762176763176764176765176766176767176768176769176770176771176772176773176774176775176776176777176778176779176780176781176782176783176784176785176786176787176788176789176790176791176792176793176794176795176796176797176798176799176800176801176802176803176804176805176806176807176808176809176810176811176812176813176814176815176816176817176818176819176820176821176822176823176824176825176826176827176828176829176830176831176832176833176834176835176836176837176838176839176840176841176842176843176844176845176846176847176848176849176850176851176852176853176854176855176856176857176858176859176860176861176862176863176864176865176866176867176868176869176870176871176872176873176874176875176876176877176878176879176880176881176882176883176884176885176886176887176888176889176890176891176892176893176894176895176896176897176898176899176900176901176902176903176904176905176906176907176908176909176910176911176912176913176914176915176916176917176918176919176920176921176922176923176924176925176926176927176928176929176930176931176932176933176934176935176936176937176938176939176940176941176942176943176944176945176946176947176948176949176950176951176952176953176954176955176956176957176958176959176960176961176962176963176964176965176966176967176968176969176970176971176972176973176974176975176976176977176978176979176980176981176982176983176984176985176986176987176988176989176990176991176992176993176994176995176996176997176998176999177000177001177002177003177004177005177006177007177008177009177010177011177012177013177014177015177016177017177018177019177020177021177022177023177024177025177026177027177028177029177030177031177032177033177034177035177036177037177038177039177040177041177042177043177044177045177046177047177048177049177050177051177052177053177054177055177056177057177058177059177060177061177062177063177064177065177066177067177068177069177070177071177072177073177074177075177076177077177078177079177080177081177082177083177084177085177086177087177088177089177090177091177092177093177094177095177096177097177098177099177100177101177102177103177104177105177106177107177108177109177110177111177112177113177114177115177116177117177118177119177120177121177122177123177124177125177126177127177128177129177130177131177132177133177134177135177136177137177138177139177140177141177142177143177144177145177146177147177148177149177150177151177152177153177154177155177156177157177158177159177160177161177162177163177164177165177166177167177168177169177170177171177172177173177174177175177176177177177178177179177180177181177182177183177184177185177186177187177188177189177190177191177192177193177194177195177196177197177198177199177200177201177202177203177204177205177206177207177208177209177210177211177212177213177214177215177216177217177218177219177220177221177222177223177224177225177226177227177228177229177230177231177232177233177234177235177236177237177238177239177240177241177242177243177244177245177246177247177248177249177250177251177252177253177254177255177256177257177258177259177260177261177262177263177264177265177266177267177268177269177270177271177272177273177274177275177276177277177278177279177280177281177282177283177284177285177286177287177288177289177290177291177292177293177294177295177296177297177298177299177300177301177302177303177304177305177306177307177308177309177310177311177312177313177314177315177316177317177318177319177320177321177322177323177324177325177326177327177328177329177330177331177332177333177334177335177336177337177338177339177340177341177342177343177344177345177346177347177348177349177350177351177352177353177354177355177356177357177358177359177360177361177362177363177364177365177366177367177368177369177370177371177372177373177374177375177376177377177378177379177380177381177382177383177384177385177386177387177388177389177390177391177392177393177394177395177396177397177398177399177400177401177402177403177404177405177406177407177408177409177410177411177412177413177414177415177416177417177418177419177420177421177422177423177424177425177426177427177428177429177430177431177432177433177434177435177436177437177438177439177440177441177442177443177444177445177446177447177448177449177450177451177452177453177454177455177456177457177458177459177460177461177462177463177464177465177466177467177468177469177470177471177472177473177474177475177476177477177478177479177480177481177482177483177484177485177486177487177488177489177490177491177492177493177494177495177496177497177498177499177500177501177502177503177504177505177506177507177508177509177510177511177512177513177514177515177516177517177518177519177520177521177522177523177524177525177526177527177528177529177530177531177532177533177534177535177536177537177538177539177540177541177542177543177544177545177546177547177548177549177550177551177552177553177554177555177556177557177558177559177560177561177562177563177564177565177566177567177568177569177570177571177572177573177574177575177576177577177578177579177580177581177582177583177584177585177586177587177588177589177590177591177592177593177594177595177596177597177598177599177600177601177602177603177604177605177606177607177608177609177610177611177612177613177614177615177616177617177618177619177620177621177622177623177624177625177626177627177628177629177630177631177632177633177634177635177636177637177638177639177640177641177642177643177644177645177646177647177648177649177650177651177652177653177654177655177656177657177658177659177660177661177662177663177664177665177666177667177668177669177670177671177672177673177674177675177676177677177678177679177680177681177682177683177684177685177686177687177688177689177690177691177692177693177694177695177696177697177698177699177700177701177702177703177704177705177706177707177708177709177710177711177712177713177714177715177716177717177718177719177720177721177722177723177724177725177726177727177728177729177730177731177732177733177734177735177736177737177738177739177740177741177742177743177744177745177746177747177748177749177750177751177752177753177754177755177756177757177758177759177760177761177762177763177764177765177766177767177768177769177770177771177772177773177774177775177776177777177778177779177780177781177782177783177784177785177786177787177788177789177790177791177792177793177794177795177796177797177798177799177800177801177802177803177804177805177806177807177808177809177810177811177812177813177814177815177816177817177818177819177820177821177822177823177824177825177826177827177828177829177830177831177832177833177834177835177836177837177838177839177840177841177842177843177844177845177846177847177848177849177850177851177852177853177854177855177856177857177858177859177860177861177862177863177864177865177866177867177868177869177870177871177872177873177874177875177876177877177878177879177880177881177882177883177884177885177886177887177888177889177890177891177892177893177894177895177896177897177898177899177900177901177902177903177904177905177906177907177908177909177910177911177912177913177914177915177916177917177918177919177920177921177922177923177924177925177926177927177928177929177930177931177932177933177934177935177936177937177938177939177940177941177942177943177944177945177946177947177948177949177950177951177952177953177954177955177956177957177958177959177960177961177962177963177964177965177966177967177968177969177970177971177972177973177974177975177976177977177978177979177980177981177982177983177984177985177986177987177988177989177990177991177992177993177994177995177996177997177998177999178000178001178002178003178004178005178006178007178008178009178010178011178012178013178014178015178016178017178018178019178020178021178022178023178024178025178026178027178028178029178030178031178032178033178034178035178036178037178038178039178040178041178042178043178044178045178046178047178048178049178050178051178052178053178054178055178056178057178058178059178060178061178062178063178064178065178066178067178068178069178070178071178072178073178074178075178076178077178078178079178080178081178082178083178084178085178086178087178088178089178090178091178092178093178094178095178096178097178098178099178100178101178102178103178104178105178106178107178108178109178110178111178112178113178114178115178116178117178118178119178120178121178122178123178124178125178126178127178128178129178130178131178132178133178134178135178136178137178138178139178140178141178142178143178144178145178146178147178148178149178150178151178152178153178154178155178156178157178158178159178160178161178162178163178164178165178166178167178168178169178170178171178172178173178174178175178176178177178178178179178180178181178182178183178184178185178186178187178188178189178190178191178192178193178194178195178196178197178198178199178200178201178202178203178204178205178206178207178208178209178210178211178212178213178214178215178216178217178218178219178220178221178222178223178224178225178226178227178228178229178230178231178232178233178234178235178236178237178238178239178240178241178242178243178244178245178246178247178248178249178250178251178252178253178254178255178256178257178258178259178260178261178262178263178264178265178266178267178268178269178270178271178272178273178274178275178276178277178278178279178280178281178282178283178284178285178286178287178288178289178290178291178292178293178294178295178296178297178298178299178300178301178302178303178304178305178306178307178308178309178310178311178312178313178314178315178316178317178318178319178320178321178322178323178324178325178326178327178328178329178330178331178332178333178334178335178336178337178338178339178340178341178342178343178344178345178346178347178348178349178350178351178352178353178354178355178356178357178358178359178360178361178362178363178364178365178366178367178368178369178370178371178372178373178374178375178376178377178378178379178380178381178382178383178384178385178386178387178388178389178390178391178392178393178394178395178396178397178398178399178400178401178402178403178404178405178406178407178408178409178410178411178412178413178414178415178416178417178418178419178420178421178422178423178424178425178426178427178428178429178430178431178432178433178434178435178436178437178438178439178440178441178442178443178444178445178446178447178448178449178450178451178452178453178454178455178456178457178458178459178460178461178462178463178464178465178466178467178468178469178470178471178472178473178474178475178476178477178478178479178480178481178482178483178484178485178486178487178488178489178490178491178492178493178494178495178496178497178498178499178500178501178502178503178504178505178506178507178508178509178510178511178512178513178514178515178516178517178518178519178520178521178522178523178524178525178526178527178528178529178530178531178532178533178534178535178536178537178538178539178540178541178542178543178544178545178546178547178548178549178550178551178552178553178554178555178556178557178558178559178560178561178562178563178564178565178566178567178568178569178570178571178572178573178574178575178576178577178578178579178580178581178582178583178584178585178586178587178588178589178590178591178592178593178594178595178596178597178598178599178600178601178602178603178604178605178606178607178608178609178610178611178612178613178614178615178616178617178618178619178620178621178622178623178624178625178626178627178628178629178630178631178632178633178634178635178636178637178638178639178640178641178642178643178644178645178646178647178648178649178650178651178652178653178654178655178656178657178658178659178660178661178662178663178664178665178666178667178668178669178670178671178672178673178674178675178676178677178678178679178680178681178682178683178684178685178686178687178688178689178690178691178692178693178694178695178696178697178698178699178700178701178702178703178704178705178706178707178708178709178710178711178712178713178714178715178716178717178718178719178720178721178722178723178724178725178726178727178728178729178730178731178732178733178734178735178736178737178738178739178740178741178742178743178744178745178746178747178748178749178750178751178752178753178754178755178756178757178758178759178760178761178762178763178764178765178766178767178768178769178770178771178772178773178774178775178776178777178778178779178780178781178782178783178784178785178786178787178788178789178790178791178792178793178794178795178796178797178798178799178800178801178802178803178804178805178806178807178808178809178810178811178812178813178814178815178816178817178818178819178820178821178822178823178824178825178826178827178828178829178830178831178832178833178834178835178836178837178838178839178840178841178842178843178844178845178846178847178848178849178850178851178852178853178854178855178856178857178858178859178860178861178862178863178864178865178866178867178868178869178870178871178872178873178874178875178876178877178878178879178880178881178882178883178884178885178886178887178888178889178890178891178892178893178894178895178896178897178898178899178900178901178902178903178904178905178906178907178908178909178910178911178912178913178914178915178916178917178918178919178920178921178922178923178924178925178926178927178928178929178930178931178932178933178934178935178936178937178938178939178940178941178942178943178944178945178946178947178948178949178950178951178952178953178954178955178956178957178958178959178960178961178962178963178964178965178966178967178968178969178970178971178972178973178974178975178976178977178978178979178980178981178982178983178984178985178986178987178988178989178990178991178992178993178994178995178996178997178998178999179000179001179002179003179004179005179006179007179008179009179010179011179012179013179014179015179016179017179018179019179020179021179022179023179024179025179026179027179028179029179030179031179032179033179034179035179036179037179038179039179040179041179042179043179044179045179046179047179048179049179050179051179052179053179054179055179056179057179058179059179060179061179062179063179064179065179066179067179068179069179070179071179072179073179074179075179076179077179078179079179080179081179082179083179084179085179086179087179088179089179090179091179092179093179094179095179096179097179098179099179100179101179102179103179104179105179106179107179108179109179110179111179112179113179114179115179116179117179118179119179120179121179122179123179124179125179126179127179128179129179130179131179132179133179134179135179136179137179138179139179140179141179142179143179144179145179146179147179148179149179150179151179152179153179154179155179156179157179158179159179160179161179162179163179164179165179166179167179168179169179170179171179172179173179174179175179176179177179178179179179180179181179182179183179184179185179186179187179188179189179190179191179192179193179194179195179196179197179198179199179200179201179202179203179204179205179206179207179208179209179210179211179212179213179214179215179216179217179218179219179220179221179222179223179224179225179226179227179228179229179230179231179232179233179234179235179236179237179238179239179240179241179242179243179244179245179246179247179248179249179250179251179252179253179254179255179256179257179258179259179260179261179262179263179264179265179266179267179268179269179270179271179272179273179274179275179276179277179278179279179280179281179282179283179284179285179286179287179288179289179290179291179292179293179294179295179296179297179298179299179300179301179302179303179304179305179306179307179308179309179310179311179312179313179314179315179316179317179318179319179320179321179322179323179324179325179326179327179328179329179330179331179332179333179334179335179336179337179338179339179340179341179342179343179344179345179346179347179348179349179350179351179352179353179354179355179356179357179358179359179360179361179362179363179364179365179366179367179368179369179370179371179372179373179374179375179376179377179378179379179380179381179382179383179384179385179386179387179388179389179390179391179392179393179394179395179396179397179398179399179400179401179402179403179404179405179406179407179408179409179410179411179412179413179414179415179416179417179418179419179420179421179422179423179424179425179426179427179428179429179430179431179432179433179434179435179436179437179438179439179440179441179442179443179444179445179446179447179448179449179450179451179452179453179454179455179456179457179458179459179460179461179462179463179464179465179466179467179468179469179470179471179472179473179474179475179476179477179478179479179480179481179482179483179484179485179486179487179488179489179490179491179492179493179494179495179496179497179498179499179500179501179502179503179504179505179506179507179508179509179510179511179512179513179514179515179516179517179518179519179520179521179522179523179524179525179526179527179528179529179530179531179532179533179534179535179536179537179538179539179540179541179542179543179544179545179546179547179548179549179550179551179552179553179554179555179556179557179558179559179560179561179562179563179564179565179566179567179568179569179570179571179572179573179574179575179576179577179578179579179580179581179582179583179584179585179586179587179588179589179590179591179592179593179594179595179596179597179598179599179600179601179602179603179604179605179606179607179608179609179610179611179612179613179614179615179616179617179618179619179620179621179622179623179624179625179626179627179628179629179630179631179632179633179634179635179636179637179638179639179640179641179642179643179644179645179646179647179648179649179650179651179652179653179654179655179656179657179658179659179660179661179662179663179664179665179666179667179668179669179670179671179672179673179674179675179676179677179678179679179680179681179682179683179684179685179686179687179688179689179690179691179692179693179694179695179696179697179698179699179700179701179702179703179704179705179706179707179708179709179710179711179712179713179714179715179716179717179718179719179720179721179722179723179724179725179726179727179728179729179730179731179732179733179734179735179736179737179738179739179740179741179742179743179744179745179746179747179748179749179750179751179752179753179754179755179756179757179758179759179760179761179762179763179764179765179766179767179768179769179770179771179772179773179774179775179776179777179778179779179780179781179782179783179784179785179786179787179788179789179790179791179792179793179794179795179796179797179798179799179800179801179802179803179804179805179806179807179808179809179810179811179812179813179814179815179816179817179818179819179820179821179822179823179824179825179826179827179828179829179830179831179832179833179834179835179836179837179838179839179840179841179842179843179844179845179846179847179848179849179850179851179852179853179854179855179856179857179858179859179860179861179862179863179864179865179866179867179868179869179870179871179872179873179874179875179876179877179878179879179880179881179882179883179884179885179886179887179888179889179890179891179892179893179894179895179896179897179898179899179900179901179902179903179904179905179906179907179908179909179910179911179912179913179914179915179916179917179918179919179920179921179922179923179924179925179926179927179928179929179930179931179932179933179934179935179936179937179938179939179940179941179942179943179944179945179946179947179948179949179950179951179952179953179954179955179956179957179958179959179960179961179962179963179964179965179966179967179968179969179970179971179972179973179974179975179976179977179978179979179980179981179982179983179984179985179986179987179988179989179990179991179992179993179994179995179996179997179998179999180000180001180002180003180004180005180006180007180008180009180010180011180012180013180014180015180016180017180018180019180020180021180022180023180024180025180026180027180028180029180030180031180032180033180034180035180036180037180038180039180040180041180042180043180044180045180046180047180048180049180050180051180052180053180054180055180056180057180058180059180060180061180062180063180064180065180066180067180068180069180070180071180072180073180074180075180076180077180078180079180080180081180082180083180084180085180086180087180088180089180090180091180092180093180094180095180096180097180098180099180100180101180102180103180104180105180106180107180108180109180110180111180112180113180114180115180116180117180118180119180120180121180122180123180124180125180126180127180128180129180130180131180132180133180134180135180136180137180138180139180140180141180142180143180144180145180146180147180148180149180150180151180152180153180154180155180156180157180158180159180160180161180162180163180164180165180166180167180168180169180170180171180172180173180174180175180176180177180178180179180180180181180182180183180184180185180186180187180188180189180190180191180192180193180194180195180196180197180198180199180200180201180202180203180204180205180206180207180208180209180210180211180212180213180214180215180216180217180218180219180220180221180222180223180224180225180226180227180228180229180230180231180232180233180234180235180236180237180238180239180240180241180242180243180244180245180246180247180248180249180250180251180252180253180254180255180256180257180258180259180260180261180262180263180264180265180266180267180268180269180270180271180272180273180274180275180276180277180278180279180280180281180282180283180284180285180286180287180288180289180290180291180292180293180294180295180296180297180298180299180300180301180302180303180304180305180306180307180308180309180310180311180312180313180314180315180316180317180318180319180320180321180322180323180324180325180326180327180328180329180330180331180332180333180334180335180336180337180338180339180340180341180342180343180344180345180346180347180348180349180350180351180352180353180354180355180356180357180358180359180360180361180362180363180364180365180366180367180368180369180370180371180372180373180374180375180376180377180378180379180380180381180382180383180384180385180386180387180388180389180390180391180392180393180394180395180396180397180398180399180400180401180402180403180404180405180406180407180408180409180410180411180412180413180414180415180416180417180418180419180420180421180422180423180424180425180426180427180428180429180430180431180432180433180434180435180436180437180438180439180440180441180442180443180444180445180446180447180448180449180450180451180452180453180454180455180456180457180458180459180460180461180462180463180464180465180466180467180468180469180470180471180472180473180474180475180476180477180478180479180480180481180482180483180484180485180486180487180488180489180490180491180492180493180494180495180496180497180498180499180500180501180502180503180504180505180506180507180508180509180510180511180512180513180514180515180516180517180518180519180520180521180522180523180524180525180526180527180528180529180530180531180532180533180534180535180536180537180538180539180540180541180542180543180544180545180546180547180548180549180550180551180552180553180554180555180556180557180558180559180560180561180562180563180564180565180566180567180568180569180570180571180572180573180574180575180576180577180578180579180580180581180582180583180584180585180586180587180588180589180590180591180592180593180594180595180596180597180598180599180600180601180602180603180604180605180606180607180608180609180610180611180612180613180614180615180616180617180618180619180620180621180622180623180624180625180626180627180628180629180630180631180632180633180634180635180636180637180638180639180640180641180642180643180644180645180646180647180648180649180650180651180652180653180654180655180656180657180658180659180660180661180662180663180664180665180666180667180668180669180670180671180672180673180674180675180676180677180678180679180680180681180682180683180684180685180686180687180688180689180690180691180692180693180694180695180696180697180698180699180700180701180702180703180704180705180706180707180708180709180710180711180712180713180714180715180716180717180718180719180720180721180722180723180724180725180726180727180728180729180730180731180732180733180734180735180736180737180738180739180740180741180742180743180744180745180746180747180748180749180750180751180752180753180754180755180756180757180758180759180760180761180762180763180764180765180766180767180768180769180770180771180772180773180774180775180776180777180778180779180780180781180782180783180784180785180786180787180788180789180790180791180792180793180794180795180796180797180798180799180800180801180802180803180804180805180806180807180808180809180810180811180812180813180814180815180816180817180818180819180820180821180822180823180824180825180826180827180828180829180830180831180832180833180834180835180836180837180838180839180840180841180842180843180844180845180846180847180848180849180850180851180852180853180854180855180856180857180858180859180860180861180862180863180864180865180866180867180868180869180870180871180872180873180874180875180876180877180878180879180880180881180882180883180884180885180886180887180888180889180890180891180892180893180894180895180896180897180898180899180900180901180902180903180904180905180906180907180908180909180910180911180912180913180914180915180916180917180918180919180920180921180922180923180924180925180926180927180928180929180930180931180932180933180934180935180936180937180938180939180940180941180942180943180944180945180946180947180948180949180950180951180952180953180954180955180956180957180958180959180960180961180962180963180964180965180966180967180968180969180970180971180972180973180974180975180976180977180978180979180980180981180982180983180984180985180986180987180988180989180990180991180992180993180994180995180996180997180998180999181000181001181002181003181004181005181006181007181008181009181010181011181012181013181014181015181016181017181018181019181020181021181022181023181024181025181026181027181028181029181030181031181032181033181034181035181036181037181038181039181040181041181042181043181044181045181046181047181048181049181050181051181052181053181054181055181056181057181058181059181060181061181062181063181064181065181066181067181068181069181070181071181072181073181074181075181076181077181078181079181080181081181082181083181084181085181086181087181088181089181090181091181092181093181094181095181096181097181098181099181100181101181102181103181104181105181106181107181108181109181110181111181112181113181114181115181116181117181118181119181120181121181122181123181124181125181126181127181128181129181130181131181132181133181134181135181136181137181138181139181140181141181142181143181144181145181146181147181148181149181150181151181152181153181154181155181156181157181158181159181160181161181162181163181164181165181166181167181168181169181170181171181172181173181174181175181176181177181178181179181180181181181182181183181184181185181186181187181188181189181190181191181192181193181194181195181196181197181198181199181200181201181202181203181204181205181206181207181208181209181210181211181212181213181214181215181216181217181218181219181220181221181222181223181224181225181226181227181228181229181230181231181232181233181234181235181236181237181238181239181240181241181242181243181244181245181246181247181248181249181250181251181252181253181254181255181256181257181258181259181260181261181262181263181264181265181266181267181268181269181270181271181272181273181274181275181276181277181278181279181280181281181282181283181284181285181286181287181288181289181290181291181292181293181294181295181296181297181298181299181300181301181302181303181304181305181306181307181308181309181310181311181312181313181314181315181316181317181318181319181320181321181322181323181324181325181326181327181328181329181330181331181332181333181334181335181336181337181338181339181340181341181342181343181344181345181346181347181348181349181350181351181352181353181354181355181356181357181358181359181360181361181362181363181364181365181366181367181368181369181370181371181372181373181374181375181376181377181378181379181380181381181382181383181384181385181386181387181388181389181390181391181392181393181394181395181396181397181398181399181400181401181402181403181404181405181406181407181408181409181410181411181412181413181414181415181416181417181418181419181420181421181422181423181424181425181426181427181428181429181430181431181432181433181434181435181436181437181438181439181440181441181442181443181444181445181446181447181448181449181450181451181452181453181454181455181456181457181458181459181460181461181462181463181464181465181466181467181468181469181470181471181472181473181474181475181476181477181478181479181480181481181482181483181484181485181486181487181488181489181490181491181492181493181494181495181496181497181498181499181500181501181502181503181504181505181506181507181508181509181510181511181512181513181514181515181516181517181518181519181520181521181522181523181524181525181526181527181528181529181530181531181532181533181534181535181536181537181538181539181540181541181542181543181544181545181546181547181548181549181550181551181552181553181554181555181556181557181558181559181560181561181562181563181564181565181566181567181568181569181570181571181572181573181574181575181576181577181578181579181580181581181582181583181584181585181586181587181588181589181590181591181592181593181594181595181596181597181598181599181600181601181602181603181604181605181606181607181608181609181610181611181612181613181614181615181616181617181618181619181620181621181622181623181624181625181626181627181628181629181630181631181632181633181634181635181636181637181638181639181640181641181642181643181644181645181646181647181648181649181650181651181652181653181654181655181656181657181658181659181660181661181662181663181664181665181666181667181668181669181670181671181672181673181674181675181676181677181678181679181680181681181682181683181684181685181686181687181688181689181690181691181692181693181694181695181696181697181698181699181700181701181702181703181704181705181706181707181708181709181710181711181712181713181714181715181716181717181718181719181720181721181722181723181724181725181726181727181728181729181730181731181732181733181734181735181736181737181738181739181740181741181742181743181744181745181746181747181748181749181750181751181752181753181754181755181756181757181758181759181760181761181762181763181764181765181766181767181768181769181770181771181772181773181774181775181776181777181778181779181780181781181782181783181784181785181786181787181788181789181790181791181792181793181794181795181796181797181798181799181800181801181802181803181804181805181806181807181808181809181810181811181812181813181814181815181816181817181818181819181820181821181822181823181824181825181826181827181828181829181830181831181832181833181834181835181836181837181838181839181840181841181842181843181844181845181846181847181848181849181850181851181852181853181854181855181856181857181858181859181860181861181862181863181864181865181866181867181868181869181870181871181872181873181874181875181876181877181878181879181880181881181882181883181884181885181886181887181888181889181890181891181892181893181894181895181896181897181898181899181900181901181902181903181904181905181906181907181908181909181910181911181912181913181914181915181916181917181918181919181920181921181922181923181924181925181926181927181928181929181930181931181932181933181934181935181936181937181938181939181940181941181942181943181944181945181946181947181948181949181950181951181952181953181954181955181956181957181958181959181960181961181962181963181964181965181966181967181968181969181970181971181972181973181974181975181976181977181978181979181980181981181982181983181984181985181986181987181988181989181990181991181992181993181994181995181996181997181998181999182000182001182002182003182004182005182006182007182008182009182010182011182012182013182014182015182016182017182018182019182020182021182022182023182024182025182026182027182028182029182030182031182032182033182034182035182036182037182038182039182040182041182042182043182044182045182046182047182048182049182050182051182052182053182054182055182056182057182058182059182060182061182062182063182064182065182066182067182068182069182070182071182072182073182074182075182076182077182078182079182080182081182082182083182084182085182086182087182088182089182090182091182092182093182094182095182096182097182098182099182100182101182102182103182104182105182106182107182108182109182110182111182112182113182114182115182116182117182118182119182120182121182122182123182124182125182126182127182128182129182130182131182132182133182134182135182136182137182138182139182140182141182142182143182144182145182146182147182148182149182150182151182152182153182154182155182156182157182158182159182160182161182162182163182164182165182166182167182168182169182170182171182172182173182174182175182176182177182178182179182180182181182182182183182184182185182186182187182188182189182190182191182192182193182194182195182196182197182198182199182200182201182202182203182204182205182206182207182208182209182210182211182212182213182214182215182216182217182218182219182220182221182222182223182224182225182226182227182228182229182230182231182232182233182234182235182236182237182238182239182240182241182242182243182244182245182246182247182248182249182250182251182252182253182254182255182256182257182258182259182260182261182262182263182264182265182266182267182268182269182270182271182272182273182274182275182276182277182278182279182280182281182282182283182284182285182286182287182288182289182290182291182292182293182294182295182296182297182298182299182300182301182302182303182304182305182306182307182308182309182310182311182312182313182314182315182316182317182318182319182320182321182322182323182324182325182326182327182328182329182330182331182332182333182334182335182336182337182338182339182340182341182342182343182344182345182346182347182348182349182350182351182352182353182354182355182356182357182358182359182360182361182362182363182364182365182366182367182368182369182370182371182372182373182374182375182376182377182378182379182380182381182382182383182384182385182386182387182388182389182390182391182392182393182394182395182396182397182398182399182400182401182402182403182404182405182406182407182408182409182410182411182412182413182414182415182416182417182418182419182420182421182422182423182424182425182426182427182428182429182430182431182432182433182434182435182436182437182438182439182440182441182442182443182444182445182446182447182448182449182450182451182452182453182454182455182456182457182458182459182460182461182462182463182464182465182466182467182468182469182470182471182472182473182474182475182476182477182478182479182480182481182482182483182484182485182486182487182488182489182490182491182492182493182494182495182496182497182498182499182500182501182502182503182504182505182506182507182508182509182510182511182512182513182514182515182516182517182518182519182520182521182522182523182524182525182526182527182528182529182530182531182532182533182534182535182536182537182538182539182540182541182542182543182544182545182546182547182548182549182550182551182552182553182554182555182556182557182558182559182560182561182562182563182564182565182566182567182568182569182570182571182572182573182574182575182576182577182578182579182580182581182582182583182584182585182586182587182588182589182590182591182592182593182594182595182596182597182598182599182600182601182602182603182604182605182606182607182608182609182610182611182612182613182614182615182616182617182618182619182620182621182622182623182624182625182626182627182628182629182630182631182632182633182634182635182636182637182638182639182640182641182642182643182644182645182646182647182648182649182650182651182652182653182654182655182656182657182658182659182660182661182662182663182664182665182666182667182668182669182670182671182672182673182674182675182676182677182678182679182680182681182682182683182684182685182686182687182688182689182690182691182692182693182694182695182696182697182698182699182700182701182702182703182704182705182706182707182708182709182710182711182712182713182714182715182716182717182718182719182720182721182722182723182724182725182726182727182728182729182730182731182732182733182734182735182736182737182738182739182740182741182742182743182744182745182746182747182748182749182750182751182752182753182754182755182756182757182758182759182760182761182762182763182764182765182766182767182768182769182770182771182772182773182774182775182776182777182778182779182780182781182782182783182784182785182786182787182788182789182790182791182792182793182794182795182796182797182798182799182800182801182802182803182804182805182806182807182808182809182810182811182812182813182814182815182816182817182818182819182820182821182822182823182824182825182826182827182828182829182830182831182832182833182834182835182836182837182838182839182840182841182842182843182844182845182846182847182848182849182850182851182852182853182854182855182856182857182858182859182860182861182862182863182864182865182866182867182868182869182870182871182872182873182874182875182876182877182878182879182880182881182882182883182884182885182886182887182888182889182890182891182892182893182894182895182896182897182898182899182900182901182902182903182904182905182906182907182908182909182910182911182912182913182914182915182916182917182918182919182920182921182922182923182924182925182926182927182928182929182930182931182932182933182934182935182936182937182938182939182940182941182942182943182944182945182946182947182948182949182950182951182952182953182954182955182956182957182958182959182960182961182962182963182964182965182966182967182968182969182970182971182972182973182974182975182976182977182978182979182980182981182982182983182984182985182986182987182988182989182990182991182992182993182994182995182996182997182998182999183000183001183002183003183004183005183006183007183008183009183010183011183012183013183014183015183016183017183018183019183020183021183022183023183024183025183026183027183028183029183030183031183032183033183034183035183036183037183038183039183040183041183042183043183044183045183046183047183048183049183050183051183052183053183054183055183056183057183058183059183060183061183062183063183064183065183066183067183068183069183070183071183072183073183074183075183076183077183078183079183080183081183082183083183084183085183086183087183088183089183090183091183092183093183094183095183096183097183098183099183100183101183102183103183104183105183106183107183108183109183110183111183112183113183114183115183116183117183118183119183120183121183122183123183124183125183126183127183128183129183130183131183132183133183134183135183136183137183138183139183140183141183142183143183144183145183146183147183148183149183150183151183152183153183154183155183156183157183158183159183160183161183162183163183164183165183166183167183168183169183170183171183172183173183174183175183176183177183178183179183180183181183182183183183184183185183186183187183188183189183190183191183192183193183194183195183196183197183198183199183200183201183202183203183204183205183206183207183208183209183210183211183212183213183214183215183216183217183218183219183220183221183222183223183224183225183226183227183228183229183230183231183232183233183234183235183236183237183238183239183240183241183242183243183244183245183246183247183248183249183250183251183252183253183254183255183256183257183258183259183260183261183262183263183264183265183266183267183268183269183270183271183272183273183274183275183276183277183278183279183280183281183282183283183284183285183286183287183288183289183290183291183292183293183294183295183296183297183298183299183300183301183302183303183304183305183306183307183308183309183310183311183312183313183314183315183316183317183318183319183320183321183322183323183324183325183326183327183328183329183330183331183332183333183334183335183336183337183338183339183340183341183342183343183344183345183346183347183348183349183350183351183352183353183354183355183356183357183358183359183360183361183362183363183364183365183366183367183368183369183370183371183372183373183374183375183376183377183378183379183380183381183382183383183384183385183386183387183388183389183390183391183392183393183394183395183396183397183398183399183400183401183402183403183404183405183406183407183408183409183410183411183412183413183414183415183416183417183418183419183420183421183422183423183424183425183426183427183428183429183430183431183432183433183434183435183436183437183438183439183440183441183442183443183444183445183446183447183448183449183450183451183452183453183454183455183456183457183458183459183460183461183462183463183464183465183466183467183468183469183470183471183472183473183474183475183476183477183478183479183480183481183482183483183484183485183486183487183488183489183490183491183492183493183494183495183496183497183498183499183500183501183502183503183504183505183506183507183508183509183510183511183512183513183514183515183516183517183518183519183520183521183522183523183524183525183526183527183528183529183530183531183532183533183534183535183536183537183538183539183540183541183542183543183544183545183546183547183548183549183550183551183552183553183554183555183556183557183558183559183560183561183562183563183564183565183566183567183568183569183570183571183572183573183574183575183576183577183578183579183580183581183582183583183584183585183586183587183588183589183590183591183592183593183594183595183596183597183598183599183600183601183602183603183604183605183606183607183608183609183610183611183612183613183614183615183616183617183618183619183620183621183622183623183624183625183626183627183628183629183630183631183632183633183634183635183636183637183638183639183640183641183642183643183644183645183646183647183648183649183650183651183652183653183654183655183656183657183658183659183660183661183662183663183664183665183666183667183668183669183670183671183672183673183674183675183676183677183678183679183680183681183682183683183684183685183686183687183688183689183690183691183692183693183694183695183696183697183698183699183700183701183702183703183704183705183706183707183708183709183710183711183712183713183714183715183716183717183718183719183720183721183722183723183724183725183726183727183728183729183730183731183732183733183734183735183736183737183738183739183740183741183742183743183744183745183746183747183748183749183750183751183752183753183754183755183756183757183758183759183760183761183762183763183764183765183766183767183768183769183770183771183772183773183774183775183776183777183778183779183780183781183782183783183784183785183786183787183788183789183790183791183792183793183794183795183796183797183798183799183800183801183802183803183804183805183806183807183808183809183810183811183812183813183814183815183816183817183818183819183820183821183822183823183824183825183826183827183828183829183830183831183832183833183834183835183836183837183838183839183840183841183842183843183844183845183846183847183848183849183850183851183852183853183854183855183856183857183858183859183860183861183862183863183864183865183866183867183868183869183870183871183872183873183874183875183876183877183878183879183880183881183882183883183884183885183886183887183888183889183890183891183892183893183894183895183896183897183898183899183900183901183902183903183904183905183906183907183908183909183910183911183912183913183914183915183916183917183918183919183920183921183922183923183924183925183926183927183928183929183930183931183932183933183934183935183936183937183938183939183940183941183942183943183944183945183946183947183948183949183950183951183952183953183954183955183956183957183958183959183960183961183962183963183964183965183966183967183968183969183970183971183972183973183974183975183976183977183978183979183980183981183982183983183984183985183986183987183988183989183990183991183992183993183994183995183996183997183998183999184000184001184002184003184004184005184006184007184008184009184010184011184012184013184014184015184016184017184018184019184020184021184022184023184024184025184026184027184028184029184030184031184032184033184034184035184036184037184038184039184040184041184042184043184044184045184046184047184048184049184050184051184052184053184054184055184056184057184058184059184060184061184062184063184064184065184066184067184068184069184070184071184072184073184074184075184076184077184078184079184080184081184082184083184084184085184086184087184088184089184090184091184092184093184094184095184096184097184098184099184100184101184102184103184104184105184106184107184108184109184110184111184112184113184114184115184116184117184118184119184120184121184122184123184124184125184126184127184128184129184130184131184132184133184134184135184136184137184138184139184140184141184142184143184144184145184146184147184148184149184150184151184152184153184154184155184156184157184158184159184160184161184162184163184164184165184166184167184168184169184170184171184172184173184174184175184176184177184178184179184180184181184182184183184184184185184186184187184188184189184190184191184192184193184194184195184196184197184198184199184200184201184202184203184204184205184206184207184208184209184210184211184212184213184214184215184216184217184218184219184220184221184222184223184224184225184226184227184228184229184230184231184232184233184234184235184236184237184238184239184240184241184242184243184244184245184246184247184248184249184250184251184252184253184254184255184256184257184258184259184260184261184262184263184264184265184266184267184268184269184270184271184272184273184274184275184276184277184278184279184280184281184282184283184284184285184286184287184288184289184290184291184292184293184294184295184296184297184298184299184300184301184302184303184304184305184306184307184308184309184310184311184312184313184314184315184316184317184318184319184320184321184322184323184324184325184326184327184328184329184330184331184332184333184334184335184336184337184338184339184340184341184342184343184344184345184346184347184348184349184350184351184352184353184354184355184356184357184358184359184360184361184362184363184364184365184366184367184368184369184370184371184372184373184374184375184376184377184378184379184380184381184382184383184384184385184386184387184388184389184390184391184392184393184394184395184396184397184398184399184400184401184402184403184404184405184406184407184408184409184410184411184412184413184414184415184416184417184418184419184420184421184422184423184424184425184426184427184428184429184430184431184432184433184434184435184436184437184438184439184440184441184442184443184444184445184446184447184448184449184450184451184452184453184454184455184456184457184458184459184460184461184462184463184464184465184466184467184468184469184470184471184472184473184474184475184476184477184478184479184480184481184482184483184484184485184486184487184488184489184490184491184492184493184494184495184496184497184498184499184500184501184502184503184504184505184506184507184508184509184510184511184512184513184514184515184516184517184518184519184520184521184522184523184524184525184526184527184528184529184530184531184532184533184534184535184536184537184538184539184540184541184542184543184544184545184546184547184548184549184550184551184552184553184554184555184556184557184558184559184560184561184562184563184564184565184566184567184568184569184570184571184572184573184574184575184576184577184578184579184580184581184582184583184584184585184586184587184588184589184590184591184592184593184594184595184596184597184598184599184600184601184602184603184604184605184606184607184608184609184610184611184612184613184614184615184616184617184618184619184620184621184622184623184624184625184626184627184628184629184630184631184632184633184634184635184636184637184638184639184640184641184642184643184644184645184646184647184648184649184650184651184652184653184654184655184656184657184658184659184660184661184662184663184664184665184666184667184668184669184670184671184672184673184674184675184676184677184678184679184680184681184682184683184684184685184686184687184688184689184690184691184692184693184694184695184696184697184698184699184700184701184702184703184704184705184706184707184708184709184710184711184712184713184714184715184716184717184718184719184720184721184722184723184724184725184726184727184728184729184730184731184732184733184734184735184736184737184738184739184740184741184742184743184744184745184746184747184748184749184750184751184752184753184754184755184756184757184758184759184760184761184762184763184764184765184766184767184768184769184770184771184772184773184774184775184776184777184778184779184780184781184782184783184784184785184786184787184788184789184790184791184792184793184794184795184796184797184798184799184800184801184802184803184804184805184806184807184808184809184810184811184812184813184814184815184816184817184818184819184820184821184822184823184824184825184826184827184828184829184830184831184832184833184834184835184836184837184838184839184840184841184842184843184844184845184846184847184848184849184850184851184852184853184854184855184856184857184858184859184860184861184862184863184864184865184866184867184868184869184870184871184872184873184874184875184876184877184878184879184880184881184882184883184884184885184886184887184888184889184890184891184892184893184894184895184896184897184898184899184900184901184902184903184904184905184906184907184908184909184910184911184912184913184914184915184916184917184918184919184920184921184922184923184924184925184926184927184928184929184930184931184932184933184934184935184936184937184938184939184940184941184942184943184944184945184946184947184948184949184950184951184952184953184954184955184956184957184958184959184960184961184962184963184964184965184966184967184968184969184970184971184972184973184974184975184976184977184978184979184980184981184982184983184984184985184986184987184988184989184990184991184992184993184994184995184996184997184998184999185000185001185002185003185004185005185006185007185008185009185010185011185012185013185014185015185016185017185018185019185020185021185022185023185024185025185026185027185028185029185030185031185032185033185034185035185036185037185038185039185040185041185042185043185044185045185046185047185048185049185050185051185052185053185054185055185056185057185058185059185060185061185062185063185064185065185066185067185068185069185070185071185072185073185074185075185076185077185078185079185080185081185082185083185084185085185086185087185088185089185090185091185092185093185094185095185096185097185098185099185100185101185102185103185104185105185106185107185108185109185110185111185112185113185114185115185116185117185118185119185120185121185122185123185124185125185126185127185128185129185130185131185132185133185134185135185136185137185138185139185140185141185142185143185144185145185146185147185148185149185150185151185152185153185154185155185156185157185158185159185160185161185162185163185164185165185166185167185168185169185170185171185172185173185174185175185176185177185178185179185180185181185182185183185184185185185186185187185188185189185190185191185192185193185194185195185196185197185198185199185200185201185202185203185204185205185206185207185208185209185210185211185212185213185214185215185216185217185218185219185220185221185222185223185224185225185226185227185228185229185230185231185232185233185234185235185236185237185238185239185240185241185242185243185244185245185246185247185248185249185250185251185252185253185254185255185256185257185258185259185260185261185262185263185264185265185266185267185268185269185270185271185272185273185274185275185276185277185278185279185280185281185282185283185284185285185286185287185288185289185290185291185292185293185294185295185296185297185298185299185300185301185302185303185304185305185306185307185308185309185310185311185312185313185314185315185316185317185318185319185320185321185322185323185324185325185326185327185328185329185330185331185332185333185334185335185336185337185338185339185340185341185342185343185344185345185346185347185348185349185350185351185352185353185354185355185356185357185358185359185360185361185362185363185364185365185366185367185368185369185370185371185372185373185374185375185376185377185378185379185380185381185382185383185384185385185386185387185388185389185390185391185392185393185394185395185396185397185398185399185400185401185402185403185404185405185406185407185408185409185410185411185412185413185414185415185416185417185418185419185420185421185422185423185424185425185426185427185428185429185430185431185432185433185434185435185436185437185438185439185440185441185442185443185444185445185446185447185448185449185450185451185452185453185454185455185456185457185458185459185460185461185462185463185464185465185466185467185468185469185470185471185472185473185474185475185476185477185478185479185480185481185482185483185484185485185486185487185488185489185490185491185492185493185494185495185496185497185498185499185500185501185502185503185504185505185506185507185508185509185510185511185512185513185514185515185516185517185518185519185520185521185522185523185524185525185526185527185528185529185530185531185532185533185534185535185536185537185538185539185540185541185542185543185544185545185546185547185548185549185550185551185552185553185554185555185556185557185558185559185560185561185562185563185564185565185566185567185568185569185570185571185572185573185574185575185576185577185578185579185580185581185582185583185584185585185586185587185588185589185590185591185592185593185594185595185596185597185598185599185600185601185602185603185604185605185606185607185608185609185610185611185612185613185614185615185616185617185618185619185620185621185622185623185624185625185626185627185628185629185630185631185632185633185634185635185636185637185638185639185640185641185642185643185644185645185646185647185648185649185650185651185652185653185654185655185656185657185658185659185660185661185662185663185664185665185666185667185668185669185670185671185672185673185674185675185676185677185678185679185680185681185682185683185684185685185686185687185688185689185690185691185692185693185694185695185696185697185698185699185700185701185702185703185704185705185706185707185708185709185710185711185712185713185714185715185716185717185718185719185720185721185722185723185724185725185726185727185728185729185730185731185732185733185734185735185736185737185738185739185740185741185742185743185744185745185746185747185748185749185750185751185752185753185754185755185756185757185758185759185760185761185762185763185764185765185766185767185768185769185770185771185772185773185774185775185776185777185778185779185780185781185782185783185784185785185786185787185788185789185790185791185792185793185794185795185796185797185798185799185800185801185802185803185804185805185806185807185808185809185810185811185812185813185814185815185816185817185818185819185820185821185822185823185824185825185826185827185828185829185830185831185832185833185834185835185836185837185838185839185840185841185842185843185844185845185846185847185848185849185850185851185852185853185854185855185856185857185858185859185860185861185862185863185864185865185866185867185868185869185870185871185872185873185874185875185876185877185878185879185880185881185882185883185884185885185886185887185888185889185890185891185892185893185894185895185896185897185898185899185900185901185902185903185904185905185906185907185908185909185910185911185912185913185914185915185916185917185918185919185920185921185922185923185924185925185926185927185928185929185930185931185932185933185934185935185936185937185938185939185940185941185942185943185944185945185946185947185948185949185950185951185952185953185954185955185956185957185958185959185960185961185962185963185964185965185966185967185968185969185970185971185972185973185974185975185976185977185978185979185980185981185982185983185984185985185986185987185988185989185990185991185992185993185994185995185996185997185998185999186000186001186002186003186004186005186006186007186008186009186010186011186012186013186014186015186016186017186018186019186020186021186022186023186024186025186026186027186028186029186030186031186032186033186034186035186036186037186038186039186040186041186042186043186044186045186046186047186048186049186050186051186052186053186054186055186056186057186058186059186060186061186062186063186064186065186066186067186068186069186070186071186072186073186074186075186076186077186078186079186080186081186082186083186084186085186086186087186088186089186090186091186092186093186094186095186096186097186098186099186100186101186102186103186104186105186106186107186108186109186110186111186112186113186114186115186116186117186118186119186120186121186122186123186124186125186126186127186128186129186130186131186132186133186134186135186136186137186138186139186140186141186142186143186144186145186146186147186148186149186150186151186152186153186154186155186156186157186158186159186160186161186162186163186164186165186166186167186168186169186170186171186172186173186174186175186176186177186178186179186180186181186182186183186184186185186186186187186188186189186190186191186192186193186194186195186196186197186198186199186200186201186202186203186204186205186206186207186208186209186210186211186212186213186214186215186216186217186218186219186220186221186222186223186224186225186226186227186228186229186230186231186232186233186234186235186236186237186238186239186240186241186242186243186244186245186246186247186248186249186250186251186252186253186254186255186256186257186258186259186260186261186262186263186264186265186266186267186268186269186270186271186272186273186274186275186276186277186278186279186280186281186282186283186284186285186286186287186288186289186290186291186292186293186294186295186296186297186298186299186300186301186302186303186304186305186306186307186308186309186310186311186312186313186314186315186316186317186318186319186320186321186322186323186324186325186326186327186328186329186330186331186332186333186334186335186336186337186338186339186340186341186342186343186344186345186346186347186348186349186350186351186352186353186354186355186356186357186358186359186360186361186362186363186364186365186366186367186368186369186370186371186372186373186374186375186376186377186378186379186380186381186382186383186384186385186386186387186388186389186390186391186392186393186394186395186396186397186398186399186400186401186402186403186404186405186406186407186408186409186410186411186412186413186414186415186416186417186418186419186420186421186422186423186424186425186426186427186428186429186430186431186432186433186434186435186436186437186438186439186440186441186442186443186444186445186446186447186448186449186450186451186452186453186454186455186456186457186458186459186460186461186462186463186464186465186466186467186468186469186470186471186472186473186474186475186476186477186478186479186480186481186482186483186484186485186486186487186488186489186490186491186492186493186494186495186496186497186498186499186500186501186502186503186504186505186506186507186508186509186510186511186512186513186514186515186516186517186518186519186520186521186522186523186524186525186526186527186528186529186530186531186532186533186534186535186536186537186538186539186540186541186542186543186544186545186546186547186548186549186550186551186552186553186554186555186556186557186558186559186560186561186562186563186564186565186566186567186568186569186570186571186572186573186574186575186576186577186578186579186580186581186582186583186584186585186586186587186588186589186590186591186592186593186594186595186596186597186598186599186600186601186602186603186604186605186606186607186608186609186610186611186612186613186614186615186616186617186618186619186620186621186622186623186624186625186626186627186628186629186630186631186632186633186634186635186636186637186638186639186640186641186642186643186644186645186646186647186648186649186650186651186652186653186654186655186656186657186658186659186660186661186662186663186664186665186666186667186668186669186670186671186672186673186674186675186676186677186678186679186680186681186682186683186684186685186686186687186688186689186690186691186692186693186694186695186696186697186698186699186700186701186702186703186704186705186706186707186708186709186710186711186712186713186714186715186716186717186718186719186720186721186722186723186724186725186726186727186728186729186730186731186732186733186734186735186736186737186738186739186740186741186742186743186744186745186746186747186748186749186750186751186752186753186754186755186756186757186758186759186760186761186762186763186764186765186766186767186768186769186770186771186772186773186774186775186776186777186778186779186780186781186782186783186784186785186786186787186788186789186790186791186792186793186794186795186796186797186798186799186800186801186802186803186804186805186806186807186808186809186810186811186812186813186814186815186816186817186818186819186820186821186822186823186824186825186826186827186828186829186830186831186832186833186834186835186836186837186838186839186840186841186842186843186844186845186846186847186848186849186850186851186852186853186854186855186856186857186858186859186860186861186862186863186864186865186866186867186868186869186870186871186872186873186874186875186876186877186878186879186880186881186882186883186884186885186886186887186888186889186890186891186892186893186894186895186896186897186898186899186900186901186902186903186904186905186906186907186908186909186910186911186912186913186914186915186916186917186918186919186920186921186922186923186924186925186926186927186928186929186930186931186932186933186934186935186936186937186938186939186940186941186942186943186944186945186946186947186948186949186950186951186952186953186954186955186956186957186958186959186960186961186962186963186964186965186966186967186968186969186970186971186972186973186974186975186976186977186978186979186980186981186982186983186984186985186986186987186988186989186990186991186992186993186994186995186996186997186998186999187000187001187002187003187004187005187006187007187008187009187010187011187012187013187014187015187016187017187018187019187020187021187022187023187024187025187026187027187028187029187030187031187032187033187034187035187036187037187038187039187040187041187042187043187044187045187046187047187048187049187050187051187052187053187054187055187056187057187058187059187060187061187062187063187064187065187066187067187068187069187070187071187072187073187074187075187076187077187078187079187080187081187082187083187084187085187086187087187088187089187090187091187092187093187094187095187096187097187098187099187100187101187102187103187104187105187106187107187108187109187110187111187112187113187114187115187116187117187118187119187120187121187122187123187124187125187126187127187128187129187130187131187132187133187134187135187136187137187138187139187140187141187142187143187144187145187146187147187148187149187150187151187152187153187154187155187156187157187158187159187160187161187162187163187164187165187166187167187168187169187170187171187172187173187174187175187176187177187178187179187180187181187182187183187184187185187186187187187188187189187190187191187192187193187194187195187196187197187198187199187200187201187202187203187204187205187206187207187208187209187210187211187212187213187214187215187216187217187218187219187220187221187222187223187224187225187226187227187228187229187230187231187232187233187234187235187236187237187238187239187240187241187242187243187244187245187246187247187248187249187250187251187252187253187254187255187256187257187258187259187260187261187262187263187264187265187266187267187268187269187270187271187272187273187274187275187276187277187278187279187280187281187282187283187284187285187286187287187288187289187290187291187292187293187294187295187296187297187298187299187300187301187302187303187304187305187306187307187308187309187310187311187312187313187314187315187316187317187318187319187320187321187322187323187324187325187326187327187328187329187330187331187332187333187334187335187336187337187338187339187340187341187342187343187344187345187346187347187348187349187350187351187352187353187354187355187356187357187358187359187360187361187362187363187364187365187366187367187368187369187370187371187372187373187374187375187376187377187378187379187380187381187382187383187384187385187386187387187388187389187390187391187392187393187394187395187396187397187398187399187400187401187402187403187404187405187406187407187408187409187410187411187412187413187414187415187416187417187418187419187420187421187422187423187424187425187426187427187428187429187430187431187432187433187434187435187436187437187438187439187440187441187442187443187444187445187446187447187448187449187450187451187452187453187454187455187456187457187458187459187460187461187462187463187464187465187466187467187468187469187470187471187472187473187474187475187476187477187478187479187480187481187482187483187484187485187486187487187488187489187490187491187492187493187494187495187496187497187498187499187500187501187502187503187504187505187506187507187508187509187510187511187512187513187514187515187516187517187518187519187520187521187522187523187524187525187526187527187528187529187530187531187532187533187534187535187536187537187538187539187540187541187542187543187544187545187546187547187548187549187550187551187552187553187554187555187556187557187558187559187560187561187562187563187564187565187566187567187568187569187570187571187572187573187574187575187576187577187578187579187580187581187582187583187584187585187586187587187588187589187590187591187592187593187594187595187596187597187598187599187600187601187602187603187604187605187606187607187608187609187610187611187612187613187614187615187616187617187618187619187620187621187622187623187624187625187626187627187628187629187630187631187632187633187634187635187636187637187638187639187640187641187642187643187644187645187646187647187648187649187650187651187652187653187654187655187656187657187658187659187660187661187662187663187664187665187666187667187668187669187670187671187672187673187674187675187676187677187678187679187680187681187682187683187684187685187686187687187688187689187690187691187692187693187694187695187696187697187698187699187700187701187702187703187704187705187706187707187708187709187710187711187712187713187714187715187716187717187718187719187720187721187722187723187724187725187726187727187728187729187730187731187732187733187734187735187736187737187738187739187740187741187742187743187744187745187746187747187748187749187750187751187752187753187754187755187756187757187758187759187760187761187762187763187764187765187766187767187768187769187770187771187772187773187774187775187776187777187778187779187780187781187782187783187784187785187786187787187788187789187790187791187792187793187794187795187796187797187798187799187800187801187802187803187804187805187806187807187808187809187810187811187812187813187814187815187816187817187818187819187820187821187822187823187824187825187826187827187828187829187830187831187832187833187834187835187836187837187838187839187840187841187842187843187844187845187846187847187848187849187850187851187852187853187854187855187856187857187858187859187860187861187862187863187864187865187866187867187868187869187870187871187872187873187874187875187876187877187878187879187880187881187882187883187884187885187886187887187888187889187890187891187892187893187894187895187896187897187898187899187900187901187902187903187904187905187906187907187908187909187910187911187912187913187914187915187916187917187918187919187920187921187922187923187924187925187926187927187928187929187930187931187932187933187934187935187936187937187938187939187940187941187942187943187944187945187946187947187948187949187950187951187952187953187954187955187956187957187958187959187960187961187962187963187964187965187966187967187968187969187970187971187972187973187974187975187976187977187978187979187980187981187982187983187984187985187986187987187988187989187990187991187992187993187994187995187996187997187998187999188000188001188002188003188004188005188006188007188008188009188010188011188012188013188014188015188016188017188018188019188020188021188022188023188024188025188026188027188028188029188030188031188032188033188034188035188036188037188038188039188040188041188042188043188044188045188046188047188048188049188050188051188052188053188054188055188056188057188058188059188060188061188062188063188064188065188066188067188068188069188070188071188072188073188074188075188076188077188078188079188080188081188082188083188084188085188086188087188088188089188090188091188092188093188094188095188096188097188098188099188100188101188102188103188104188105188106188107188108188109188110188111188112188113188114188115188116188117188118188119188120188121188122188123188124188125188126188127188128188129188130188131188132188133188134188135188136188137188138188139188140188141188142188143188144188145188146188147188148188149188150188151188152188153188154188155188156188157188158188159188160188161188162188163188164188165188166188167188168188169188170188171188172188173188174188175188176188177188178188179188180188181188182188183188184188185188186188187188188188189188190188191188192188193188194188195188196188197188198188199188200188201188202188203188204188205188206188207188208188209188210188211188212188213188214188215188216188217188218188219188220188221188222188223188224188225188226188227188228188229188230188231188232188233188234188235188236188237188238188239188240188241188242188243188244188245188246188247188248188249188250188251188252188253188254188255188256188257188258188259188260188261188262188263188264188265188266188267188268188269188270188271188272188273188274188275188276188277188278188279188280188281188282188283188284188285188286188287188288188289188290188291188292188293188294188295188296188297188298188299188300188301188302188303188304188305188306188307188308188309188310188311188312188313188314188315188316188317188318188319188320188321188322188323188324188325188326188327188328188329188330188331188332188333188334188335188336188337188338188339188340188341188342188343188344188345188346188347188348188349188350188351188352188353188354188355188356188357188358188359188360188361188362188363188364188365188366188367188368188369188370188371188372188373188374188375188376188377188378188379188380188381188382188383188384188385188386188387188388188389188390188391188392188393188394188395188396188397188398188399188400188401188402188403188404188405188406188407188408188409188410188411188412188413188414188415188416188417188418188419188420188421188422188423188424188425188426188427188428188429188430188431188432188433188434188435188436188437188438188439188440188441188442188443188444188445188446188447188448188449188450188451188452188453188454188455188456188457188458188459188460188461188462188463188464188465188466188467188468188469188470188471188472188473188474188475188476188477188478188479188480188481188482188483188484188485188486188487188488188489188490188491188492188493188494188495188496188497188498188499188500188501188502188503188504188505188506188507188508188509188510188511188512188513188514188515188516188517188518188519188520188521188522188523188524188525188526188527188528188529188530188531188532188533188534188535188536188537188538188539188540188541188542188543188544188545188546188547188548188549188550188551188552188553188554188555188556188557188558188559188560188561188562188563188564188565188566188567188568188569188570188571188572188573188574188575188576188577188578188579188580188581188582188583188584188585188586188587188588188589188590188591188592188593188594188595188596188597188598188599188600188601188602188603188604188605188606188607188608188609188610188611188612188613188614188615188616188617188618188619188620188621188622188623188624188625188626188627188628188629188630188631188632188633188634188635188636188637188638188639188640188641188642188643188644188645188646188647188648188649188650188651188652188653188654188655188656188657188658188659188660188661188662188663188664188665188666188667188668188669188670188671188672188673188674188675188676188677188678188679188680188681188682188683188684188685188686188687188688188689188690188691188692188693188694188695188696188697188698188699188700188701188702188703188704188705188706188707188708188709188710188711188712188713188714188715188716188717188718188719188720188721188722188723188724188725188726188727188728188729188730188731188732188733188734188735188736188737188738188739188740188741188742188743188744188745188746188747188748188749188750188751188752188753188754188755188756188757188758188759188760188761188762188763188764188765188766188767188768188769188770188771188772188773188774188775188776188777188778188779188780188781188782188783188784188785188786188787188788188789188790188791188792188793188794188795188796188797188798188799188800188801188802188803188804188805188806188807188808188809188810188811188812188813188814188815188816188817188818188819188820188821188822188823188824188825188826188827188828188829188830188831188832188833188834188835188836188837188838188839188840188841188842188843188844188845188846188847188848188849188850188851188852188853188854188855188856188857188858188859188860188861188862188863188864188865188866188867188868188869188870188871188872188873188874188875188876188877188878188879188880188881188882188883188884188885188886188887188888188889188890188891188892188893188894188895188896188897188898188899188900188901188902188903188904188905188906188907188908188909188910188911188912188913188914188915188916188917188918188919188920188921188922188923188924188925188926188927188928188929188930188931188932188933188934188935188936188937188938188939188940188941188942188943188944188945188946188947188948188949188950188951188952188953188954188955188956188957188958188959188960188961188962188963188964188965188966188967188968188969188970188971188972188973188974188975188976188977188978188979188980188981188982188983188984188985188986188987188988188989188990188991188992188993188994188995188996188997188998188999189000189001189002189003189004189005189006189007189008189009189010189011189012189013189014189015189016189017189018189019189020189021189022189023189024189025189026189027189028189029189030189031189032189033189034189035189036189037189038189039189040189041189042189043189044189045189046189047189048189049189050189051189052189053189054189055189056189057189058189059189060189061189062189063189064189065189066189067189068189069189070189071189072189073189074189075189076189077189078189079189080189081189082189083189084189085189086189087189088189089189090189091189092189093189094189095189096189097189098189099189100189101189102189103189104189105189106189107189108189109189110189111189112189113189114189115189116189117189118189119189120189121189122189123189124189125189126189127189128189129189130189131189132189133189134189135189136189137189138189139189140189141189142189143189144189145189146189147189148189149189150189151189152189153189154189155189156189157189158189159189160189161189162189163189164189165189166189167189168189169189170189171189172189173189174189175189176189177189178189179189180189181189182189183189184189185189186189187189188189189189190189191189192189193189194189195189196189197189198189199189200189201189202189203189204189205189206189207189208189209189210189211189212189213189214189215189216189217189218189219189220189221189222189223189224189225189226189227189228189229189230189231189232189233189234189235189236189237189238189239189240189241189242189243189244189245189246189247189248189249189250189251189252189253189254189255189256189257189258189259189260189261189262189263189264189265189266189267189268189269189270189271189272189273189274189275189276189277189278189279189280189281189282189283189284189285189286189287189288189289189290189291189292189293189294189295189296189297189298189299189300189301189302189303189304189305189306189307189308189309189310189311189312189313189314189315189316189317189318189319189320189321189322189323189324189325189326189327189328189329189330189331189332189333189334189335189336189337189338189339189340189341189342189343189344189345189346189347189348189349189350189351189352189353189354189355189356189357189358189359189360189361189362189363189364189365189366189367189368189369189370189371189372189373189374189375189376189377189378189379189380189381189382189383189384189385189386189387189388189389189390189391189392189393189394189395189396189397189398189399189400189401189402189403189404189405189406189407189408189409189410189411189412189413189414189415189416189417189418189419189420189421189422189423189424189425189426189427189428189429189430189431189432189433189434189435189436189437189438189439189440189441189442189443189444189445189446189447189448189449189450189451189452189453189454189455189456189457189458189459189460189461189462189463189464189465189466189467189468189469189470189471189472189473189474189475189476189477189478189479189480189481189482189483189484189485189486189487189488189489189490189491189492189493189494189495189496189497189498189499189500189501189502189503189504189505189506189507189508189509189510189511189512189513189514189515189516189517189518189519189520189521189522189523189524189525189526189527189528189529189530189531189532189533189534189535189536189537189538189539189540189541189542189543189544189545189546189547189548189549189550189551189552189553189554189555189556189557189558189559189560189561189562189563189564189565189566189567189568189569189570189571189572189573189574189575189576189577189578189579189580189581189582189583189584189585189586189587189588189589189590189591189592189593189594189595189596189597189598189599189600189601189602189603189604189605189606189607189608189609189610189611189612189613189614189615189616189617189618189619189620189621189622189623189624189625189626189627189628189629189630189631189632189633189634189635189636189637189638189639189640189641189642189643189644189645189646189647189648189649189650189651189652189653189654189655189656189657189658189659189660189661189662189663189664189665189666189667189668189669189670189671189672189673189674189675189676189677189678189679189680189681189682189683189684189685189686189687189688189689189690189691189692189693189694189695189696189697189698189699189700189701189702189703189704189705189706189707189708189709189710189711189712189713189714189715189716189717189718189719189720189721189722189723189724189725189726189727189728189729189730189731189732189733189734189735189736189737189738189739189740189741189742189743189744189745189746189747189748189749189750189751189752189753189754189755189756189757189758189759189760189761189762189763189764189765189766189767189768189769189770189771189772189773189774189775189776189777189778189779189780189781189782189783189784189785189786189787189788189789189790189791189792189793189794189795189796189797189798189799189800189801189802189803189804189805189806189807189808189809189810189811189812189813189814189815189816189817189818189819189820189821189822189823189824189825189826189827189828189829189830189831189832189833189834189835189836189837189838189839189840189841189842189843189844189845189846189847189848189849189850189851189852189853189854189855189856189857189858189859189860189861189862189863189864189865189866189867189868189869189870189871189872189873189874189875189876189877189878189879189880189881189882189883189884189885189886189887189888189889189890189891189892189893189894189895189896189897189898189899189900189901189902189903189904189905189906189907189908189909189910189911189912189913189914189915189916189917189918189919189920189921189922189923189924189925189926189927189928189929189930189931189932189933189934189935189936189937189938189939189940189941189942189943189944189945189946189947189948189949189950189951189952189953189954189955189956189957189958189959189960189961189962189963189964189965189966189967189968189969189970189971189972189973189974189975189976189977189978189979189980189981189982189983189984189985189986189987189988189989189990189991189992189993189994189995189996189997189998189999190000190001190002190003190004190005190006190007190008190009190010190011190012190013190014190015190016190017190018190019190020190021190022190023190024190025190026190027190028190029190030190031190032190033190034190035190036190037190038190039190040190041190042190043190044190045190046190047190048190049190050190051190052190053190054190055190056190057190058190059190060190061190062190063190064190065190066190067190068190069190070190071190072190073190074190075190076190077190078190079190080190081190082190083190084190085190086190087190088190089190090190091190092190093190094190095190096190097190098190099190100190101190102190103190104190105190106190107190108190109190110190111190112190113190114190115190116190117190118190119190120190121190122190123190124190125190126190127190128190129190130190131190132190133190134190135190136190137190138190139190140190141190142190143190144190145190146190147190148190149190150190151190152190153190154190155190156190157190158190159190160190161190162190163190164190165190166190167190168190169190170190171190172190173190174190175190176190177190178190179190180190181190182190183190184190185190186190187190188190189190190190191190192190193190194190195190196190197190198190199190200190201190202190203190204190205190206190207190208190209190210190211190212190213190214190215190216190217190218190219190220190221190222190223190224190225190226190227190228190229190230190231190232190233190234190235190236190237190238190239190240190241190242190243190244190245190246190247190248190249190250190251190252190253190254190255190256190257190258190259190260190261190262190263190264190265190266190267190268190269190270190271190272190273190274190275190276190277190278190279190280190281190282190283190284190285190286190287190288190289190290190291190292190293190294190295190296190297190298190299190300190301190302190303190304190305190306190307190308190309190310190311190312190313190314190315190316190317190318190319190320190321190322190323190324190325190326190327190328190329190330190331190332190333190334190335190336190337190338190339190340190341190342190343190344190345190346190347190348190349190350190351190352190353190354190355190356190357190358190359190360190361190362190363190364190365190366190367190368190369190370190371190372190373190374190375190376190377190378190379190380190381190382190383190384190385190386190387190388190389190390190391190392190393190394190395190396190397190398190399190400190401190402190403190404190405190406190407190408190409190410190411190412190413190414190415190416190417190418190419190420190421190422190423190424190425190426190427190428190429190430190431190432190433190434190435190436190437190438190439190440190441190442190443190444190445190446190447190448190449190450190451190452190453190454190455190456190457190458190459190460190461190462190463190464190465190466190467190468190469190470190471190472190473190474190475190476190477190478190479190480190481190482190483190484190485190486190487190488190489190490190491190492190493190494190495190496190497190498190499190500190501190502190503190504190505190506190507190508190509190510190511190512190513190514190515190516190517190518190519190520190521190522190523190524190525190526190527190528190529190530190531190532190533190534190535190536190537190538190539190540190541190542190543190544190545190546190547190548190549190550190551190552190553190554190555190556190557190558190559190560190561190562190563190564190565190566190567190568190569190570190571190572190573190574190575190576190577190578190579190580190581190582190583190584190585190586190587190588190589190590190591190592190593190594190595190596190597190598190599190600190601190602190603190604190605190606190607190608190609190610190611190612190613190614190615190616190617190618190619190620190621190622190623190624190625190626190627190628190629190630190631190632190633190634190635190636190637190638190639190640190641190642190643190644190645190646190647190648190649190650190651190652190653190654190655190656190657190658190659190660190661190662190663190664190665190666190667190668190669190670190671190672190673190674190675190676190677190678190679190680190681190682190683190684190685190686190687190688190689190690190691190692190693190694190695190696190697190698190699190700190701190702190703190704190705190706190707190708190709190710190711190712190713190714190715190716190717190718190719190720190721190722190723190724190725190726190727190728190729190730190731190732190733190734190735190736190737190738190739190740190741190742190743190744190745190746190747190748190749190750190751190752190753190754190755190756190757190758190759190760190761190762190763190764190765190766190767190768190769190770190771190772190773190774190775190776190777190778190779190780190781190782190783190784190785190786190787190788190789190790190791190792190793190794190795190796190797190798190799190800190801190802190803190804190805190806190807190808190809190810190811190812190813190814190815190816190817190818190819190820190821190822190823190824190825190826190827190828190829190830190831190832190833190834190835190836190837190838190839190840190841190842190843190844190845190846190847190848190849190850190851190852190853190854190855190856190857190858190859190860190861190862190863190864190865190866190867190868190869190870190871190872190873190874190875190876190877190878190879190880190881190882190883190884190885190886190887190888190889190890190891190892190893190894190895190896190897190898190899190900190901190902190903190904190905190906190907190908190909190910190911190912190913190914190915190916190917190918190919190920190921190922190923190924190925190926190927190928190929190930190931190932190933190934190935190936190937190938190939190940190941190942190943190944190945190946190947190948190949190950190951190952190953190954190955190956190957190958190959190960190961190962190963190964190965190966190967190968190969190970190971190972190973190974190975190976190977190978190979190980190981190982190983190984190985190986190987190988190989190990190991190992190993190994190995190996190997190998190999191000191001191002191003191004191005191006191007191008191009191010191011191012191013191014191015191016191017191018191019191020191021191022191023191024191025191026191027191028191029191030191031191032191033191034191035191036191037191038191039191040191041191042191043191044191045191046191047191048191049191050191051191052191053191054191055191056191057191058191059191060191061191062191063191064191065191066191067191068191069191070191071191072191073191074191075191076191077191078191079191080191081191082191083191084191085191086191087191088191089191090191091191092191093191094191095191096191097191098191099191100191101191102191103191104191105191106191107191108191109191110191111191112191113191114191115191116191117191118191119191120191121191122191123191124191125191126191127191128191129191130191131191132191133191134191135191136191137191138191139191140191141191142191143191144191145191146191147191148191149191150191151191152191153191154191155191156191157191158191159191160191161191162191163191164191165191166191167191168191169191170191171191172191173191174191175191176191177191178191179191180191181191182191183191184191185191186191187191188191189191190191191191192191193191194191195191196191197191198191199191200191201191202191203191204191205191206191207191208191209191210191211191212191213191214191215191216191217191218191219191220191221191222191223191224191225191226191227191228191229191230191231191232191233191234191235191236191237191238191239191240191241191242191243191244191245191246191247191248191249191250191251191252191253191254191255191256191257191258191259191260191261191262191263191264191265191266191267191268191269191270191271191272191273191274191275191276191277191278191279191280191281191282191283191284191285191286191287191288191289191290191291191292191293191294191295191296191297191298191299191300191301191302191303191304191305191306191307191308191309191310191311191312191313191314191315191316191317191318191319191320191321191322191323191324191325191326191327191328191329191330191331191332191333191334191335191336191337191338191339191340191341191342191343191344191345191346191347191348191349191350191351191352191353191354191355191356191357191358191359191360191361191362191363191364191365191366191367191368191369191370191371191372191373191374191375191376191377191378191379191380191381191382191383191384191385191386191387191388191389191390191391191392191393191394191395191396191397191398191399191400191401191402191403191404191405191406191407191408191409191410191411191412191413191414191415191416191417191418191419191420191421191422191423191424191425191426191427191428191429191430191431191432191433191434191435191436191437191438191439191440191441191442191443191444191445191446191447191448191449191450191451191452191453191454191455191456191457191458191459191460191461191462191463191464191465191466191467191468191469191470191471191472191473191474191475191476191477191478191479191480191481191482191483191484191485191486191487191488191489191490191491191492191493191494191495191496191497191498191499191500191501191502191503191504191505191506191507191508191509191510191511191512191513191514191515191516191517191518191519191520191521191522191523191524191525191526191527191528191529191530191531191532191533191534191535191536191537191538191539191540191541191542191543191544191545191546191547191548191549191550191551191552191553191554191555191556191557191558191559191560191561191562191563191564191565191566191567191568191569191570191571191572191573191574191575191576191577191578191579191580191581191582191583191584191585191586191587191588191589191590191591191592191593191594191595191596191597191598191599191600191601191602191603191604191605191606191607191608191609191610191611191612191613191614191615191616191617191618191619191620191621191622191623191624191625191626191627191628191629191630191631191632191633191634191635191636191637191638191639191640191641191642191643191644191645191646191647191648191649191650191651191652191653191654191655191656191657191658191659191660191661191662191663191664191665191666191667191668191669191670191671191672191673191674191675191676191677191678191679191680191681191682191683191684191685191686191687191688191689191690191691191692191693191694191695191696191697191698191699191700191701191702191703191704191705191706191707191708191709191710191711191712191713191714191715191716191717191718191719191720191721191722191723191724191725191726191727191728191729191730191731191732191733191734191735191736191737191738191739191740191741191742191743191744191745191746191747191748191749191750191751191752191753191754191755191756191757191758191759191760191761191762191763191764191765191766191767191768191769191770191771191772191773191774191775191776191777191778191779191780191781191782191783191784191785191786191787191788191789191790191791191792191793191794191795191796191797191798191799191800191801191802191803191804191805191806191807191808191809191810191811191812191813191814191815191816191817191818191819191820191821191822191823191824191825191826191827191828191829191830191831191832191833191834191835191836191837191838191839191840191841191842191843191844191845191846191847191848191849191850191851191852191853191854191855191856191857191858191859191860191861191862191863191864191865191866191867191868191869191870191871191872191873191874191875191876191877191878191879191880191881191882191883191884191885191886191887191888191889191890191891191892191893191894191895191896191897191898191899191900191901191902191903191904191905191906191907191908191909191910191911191912191913191914191915191916191917191918191919191920191921191922191923191924191925191926191927191928191929191930191931191932191933191934191935191936191937191938191939191940191941191942191943191944191945191946191947191948191949191950191951191952191953191954191955191956191957191958191959191960191961191962191963191964191965191966191967191968191969191970191971191972191973191974191975191976191977191978191979191980191981191982191983191984191985191986191987191988191989191990191991191992191993191994191995191996191997191998191999192000192001192002192003192004192005192006192007192008192009192010192011192012192013192014192015192016192017192018192019192020192021192022192023192024192025192026192027192028192029192030192031192032192033192034192035192036192037192038192039192040192041192042192043192044192045192046192047192048192049192050192051192052192053192054192055192056192057192058192059192060192061192062192063192064192065192066192067192068192069192070192071192072192073192074192075192076192077192078192079192080192081192082192083192084192085192086192087192088192089192090192091192092192093192094192095192096192097192098192099192100192101192102192103192104192105192106192107192108192109192110192111192112192113192114192115192116192117192118192119192120192121192122192123192124192125192126192127192128192129192130192131192132192133192134192135192136192137192138192139192140192141192142192143192144192145192146192147192148192149192150192151192152192153192154192155192156192157192158192159192160192161192162192163192164192165192166192167192168192169192170192171192172192173192174192175192176192177192178192179192180192181192182192183192184192185192186192187192188192189192190192191192192192193192194192195192196192197192198192199192200192201192202192203192204192205192206192207192208192209192210192211192212192213192214192215192216192217192218192219192220192221192222192223192224192225192226192227192228192229192230192231192232192233192234192235192236192237192238192239192240192241192242192243192244192245192246192247192248192249192250192251192252192253192254192255192256192257192258192259192260192261192262192263192264192265192266192267192268192269192270192271192272192273192274192275192276192277192278192279192280192281192282192283192284192285192286192287192288192289192290192291192292192293192294192295192296192297192298192299192300192301192302192303192304192305192306192307192308192309192310192311192312192313192314192315192316192317192318192319192320192321192322192323192324192325192326192327192328192329192330192331192332192333192334192335192336192337192338192339192340192341192342192343192344192345192346192347192348192349192350192351192352192353192354192355192356192357192358192359192360192361192362192363192364192365192366192367192368192369192370192371192372192373192374192375192376192377192378192379192380192381192382192383192384192385192386192387192388192389192390192391192392192393192394192395192396192397192398192399192400192401192402192403192404192405192406192407192408192409192410192411192412192413192414192415192416192417192418192419192420192421192422192423192424192425192426192427192428192429192430192431192432192433192434192435192436192437192438192439192440192441192442192443192444192445192446192447192448192449192450192451192452192453192454192455192456192457192458192459192460192461192462192463192464192465192466192467192468192469192470192471192472192473192474192475192476192477192478192479192480192481192482192483192484192485192486192487192488192489192490192491192492192493192494192495192496192497192498192499192500192501192502192503192504192505192506192507192508192509192510192511192512192513192514192515192516192517192518192519192520192521192522192523192524192525192526192527192528192529192530192531192532192533192534192535192536192537192538192539192540192541192542192543192544192545192546192547192548192549192550192551192552192553192554192555192556192557192558192559192560192561192562192563192564192565192566192567192568192569192570192571192572192573192574192575192576192577192578192579192580192581192582192583192584192585192586192587192588192589192590192591192592192593192594192595192596192597192598192599192600192601192602192603192604192605192606192607192608192609192610192611192612192613192614192615192616192617192618192619192620192621192622192623192624192625192626192627192628192629192630192631192632192633192634192635192636192637192638192639192640192641192642192643192644192645192646192647192648192649192650192651192652192653192654192655192656192657192658192659192660192661192662192663192664192665192666192667192668192669192670192671192672192673192674192675192676192677192678192679192680192681192682192683192684192685192686192687192688192689192690192691192692192693192694192695192696192697192698192699192700192701192702192703192704192705192706192707192708192709192710192711192712192713192714192715192716192717192718192719192720192721192722192723192724192725192726192727192728192729192730192731192732192733192734192735192736192737192738192739192740192741192742192743192744192745192746192747192748192749192750192751192752192753192754192755192756192757192758192759192760192761192762192763192764192765192766192767192768192769192770192771192772192773192774192775192776192777192778192779192780192781192782192783192784192785192786192787192788192789192790192791192792192793192794192795192796192797192798192799192800192801192802192803192804192805192806192807192808192809192810192811192812192813192814192815192816192817192818192819192820192821192822192823192824192825192826192827192828192829192830192831192832192833192834192835192836192837192838192839192840192841192842192843192844192845192846192847192848192849192850192851192852192853192854192855192856192857192858192859192860192861192862192863192864192865192866192867192868192869192870192871192872192873192874192875192876192877192878192879192880192881192882192883192884192885192886192887192888192889192890192891192892192893192894192895192896192897192898192899192900192901192902192903192904192905192906192907192908192909192910192911192912192913192914192915192916192917192918192919192920192921192922192923192924192925192926192927192928192929192930192931192932192933192934192935192936192937192938192939192940192941192942192943192944192945192946192947192948192949192950192951192952192953192954192955192956192957192958192959192960192961192962192963192964192965192966192967192968192969192970192971192972192973192974192975192976192977192978192979192980192981192982192983192984192985192986192987192988192989192990192991192992192993192994192995192996192997192998192999193000193001193002193003193004193005193006193007193008193009193010193011193012193013193014193015193016193017193018193019193020193021193022193023193024193025193026193027193028193029193030193031193032193033193034193035193036193037193038193039193040193041193042193043193044193045193046193047193048193049193050193051193052193053193054193055193056193057193058193059193060193061193062193063193064193065193066193067193068193069193070193071193072193073193074193075193076193077193078193079193080193081193082193083193084193085193086193087193088193089193090193091193092193093193094193095193096193097193098193099193100193101193102193103193104193105193106193107193108193109193110193111193112193113193114193115193116193117193118193119193120193121193122193123193124193125193126193127193128193129193130193131193132193133193134193135193136193137193138193139193140193141193142193143193144193145193146193147193148193149193150193151193152193153193154193155193156193157193158193159193160193161193162193163193164193165193166193167193168193169193170193171193172193173193174193175193176193177193178193179193180193181193182193183193184193185193186193187193188193189193190193191193192193193193194193195193196193197193198193199193200193201193202193203193204193205193206193207193208193209193210193211193212193213193214193215193216193217193218193219193220193221193222193223193224193225193226193227193228193229193230193231193232193233193234193235193236193237193238193239193240193241193242193243193244193245193246193247193248193249193250193251193252193253193254193255193256193257193258193259193260193261193262193263193264193265193266193267193268193269193270193271193272193273193274193275193276193277193278193279193280193281193282193283193284193285193286193287193288193289193290193291193292193293193294193295193296193297193298193299193300193301193302193303193304193305193306193307193308193309193310193311193312193313193314193315193316193317193318193319193320193321193322193323193324193325193326193327193328193329193330193331193332193333193334193335193336193337193338193339193340193341193342193343193344193345193346193347193348193349193350193351193352193353193354193355193356193357193358193359193360193361193362193363193364193365193366193367193368193369193370193371193372193373193374193375193376193377193378193379193380193381193382193383193384193385193386193387193388193389193390193391193392193393193394193395193396193397193398193399193400193401193402193403193404193405193406193407193408193409193410193411193412193413193414193415193416193417193418193419193420193421193422193423193424193425193426193427193428193429193430193431193432193433193434193435193436193437193438193439193440193441193442193443193444193445193446193447193448193449193450193451193452193453193454193455193456193457193458193459193460193461193462193463193464193465193466193467193468193469193470193471193472193473193474193475193476193477193478193479193480193481193482193483193484193485193486193487193488193489193490193491193492193493193494193495193496193497193498193499193500193501193502193503193504193505193506193507193508193509193510193511193512193513193514193515193516193517193518193519193520193521193522193523193524193525193526193527193528193529193530193531193532193533193534193535193536193537193538193539193540193541193542193543193544193545193546193547193548193549193550193551193552193553193554193555193556193557193558193559193560193561193562193563193564193565193566193567193568193569193570193571193572193573193574193575193576193577193578193579193580193581193582193583193584193585193586193587193588193589193590193591193592193593193594193595193596193597193598193599193600193601193602193603193604193605193606193607193608193609193610193611193612193613193614193615193616193617193618193619193620193621193622193623193624193625193626193627193628193629193630193631193632193633193634193635193636193637193638193639193640193641193642193643193644193645193646193647193648193649193650193651193652193653193654193655193656193657193658193659193660193661193662193663193664193665193666193667193668193669193670193671193672193673193674193675193676193677193678193679193680193681193682193683193684193685193686193687193688193689193690193691193692193693193694193695193696193697193698193699193700193701193702193703193704193705193706193707193708193709193710193711193712193713193714193715193716193717193718193719193720193721193722193723193724193725193726193727193728193729193730193731193732193733193734193735193736193737193738193739193740193741193742193743193744193745193746193747193748193749193750193751193752193753193754193755193756193757193758193759193760193761193762193763193764193765193766193767193768193769193770193771193772193773193774193775193776193777193778193779193780193781193782193783193784193785193786193787193788193789193790193791193792193793193794193795193796193797193798193799193800193801193802193803193804193805193806193807193808193809193810193811193812193813193814193815193816193817193818193819193820193821193822193823193824193825193826193827193828193829193830193831193832193833193834193835193836193837193838193839193840193841193842193843193844193845193846193847193848193849193850193851193852193853193854193855193856193857193858193859193860193861193862193863193864193865193866193867193868193869193870193871193872193873193874193875193876193877193878193879193880193881193882193883193884193885193886193887193888193889193890193891193892193893193894193895193896193897193898193899193900193901193902193903193904193905193906193907193908193909193910193911193912193913193914193915193916193917193918193919193920193921193922193923193924193925193926193927193928193929193930193931193932193933193934193935193936193937193938193939193940193941193942193943193944193945193946193947193948193949193950193951193952193953193954193955193956193957193958193959193960193961193962193963193964193965193966193967193968193969193970193971193972193973193974193975193976193977193978193979193980193981193982193983193984193985193986193987193988193989193990193991193992193993193994193995193996193997193998193999194000194001194002194003194004194005194006194007194008194009194010194011194012194013194014194015194016194017194018194019194020194021194022194023194024194025194026194027194028194029194030194031194032194033194034194035194036194037194038194039194040194041194042194043194044194045194046194047194048194049194050194051194052194053194054194055194056194057194058194059194060194061194062194063194064194065194066194067194068194069194070194071194072194073194074194075194076194077194078194079194080194081194082194083194084194085194086194087194088194089194090194091194092194093194094194095194096194097194098194099194100194101194102194103194104194105194106194107194108194109194110194111194112194113194114194115194116194117194118194119194120194121194122194123194124194125194126194127194128194129194130194131194132194133194134194135194136194137194138194139194140194141194142194143194144194145194146194147194148194149194150194151194152194153194154194155194156194157194158194159194160194161194162194163194164194165194166194167194168194169194170194171194172194173194174194175194176194177194178194179194180194181194182194183194184194185194186194187194188194189194190194191194192194193194194194195194196194197194198194199194200194201194202194203194204194205194206194207194208194209194210194211194212194213194214194215194216194217194218194219194220194221194222194223194224194225194226194227194228194229194230194231194232194233194234194235194236194237194238194239194240194241194242194243194244194245194246194247194248194249194250194251194252194253194254194255194256194257194258194259194260194261194262194263194264194265194266194267194268194269194270194271194272194273194274194275194276194277194278194279194280194281194282194283194284194285194286194287194288194289194290194291194292194293194294194295194296194297194298194299194300194301194302194303194304194305194306194307194308194309194310194311194312194313194314194315194316194317194318194319194320194321194322194323194324194325194326194327194328194329194330194331194332194333194334194335194336194337194338194339194340194341194342194343194344194345194346194347194348194349194350194351194352194353194354194355194356194357194358194359194360194361194362194363194364194365194366194367194368194369194370194371194372194373194374194375194376194377194378194379194380194381194382194383194384194385194386194387194388194389194390194391194392194393194394194395194396194397194398194399194400194401194402194403194404194405194406194407194408194409194410194411194412194413194414194415194416194417194418194419194420194421194422194423194424194425194426194427194428194429194430194431194432194433194434194435194436194437194438194439194440194441194442194443194444194445194446194447194448194449194450194451194452194453194454194455194456194457194458194459194460194461194462194463194464194465194466194467194468194469194470194471194472194473194474194475194476194477194478194479194480194481194482194483194484194485194486194487194488194489194490194491194492194493194494194495194496194497194498194499194500194501194502194503194504194505194506194507194508194509194510194511194512194513194514194515194516194517194518194519194520194521194522194523194524194525194526194527194528194529194530194531194532194533194534194535194536194537194538194539194540194541194542194543194544194545194546194547194548194549194550194551194552194553194554194555194556194557194558194559194560194561194562194563194564194565194566194567194568194569194570194571194572194573194574194575194576194577194578194579194580194581194582194583194584194585194586194587194588194589194590194591194592194593194594194595194596194597194598194599194600194601194602194603194604194605194606194607194608194609194610194611194612194613194614194615194616194617194618194619194620194621194622194623194624194625194626194627194628194629194630194631194632194633194634194635194636194637194638194639194640194641194642194643194644194645194646194647194648194649194650194651194652194653194654194655194656194657194658194659194660194661194662194663194664194665194666194667194668194669194670194671194672194673194674194675194676194677194678194679194680194681194682194683194684194685194686194687194688194689194690194691194692194693194694194695194696194697194698194699194700194701194702194703194704194705194706194707194708194709194710194711194712194713194714194715194716194717194718194719194720194721194722194723194724194725194726194727194728194729194730194731194732194733194734194735194736194737194738194739194740194741194742194743194744194745194746194747194748194749194750194751194752194753194754194755194756194757194758194759194760194761194762194763194764194765194766194767194768194769194770194771194772194773194774194775194776194777194778194779194780194781194782194783194784194785194786194787194788194789194790194791194792194793194794194795194796194797194798194799194800194801194802194803194804194805194806194807194808194809194810194811194812194813194814194815194816194817194818194819194820194821194822194823194824194825194826194827194828194829194830194831194832194833194834194835194836194837194838194839194840194841194842194843194844194845194846194847194848194849194850194851194852194853194854194855194856194857194858194859194860194861194862194863194864194865194866194867194868194869194870194871194872194873194874194875194876194877194878194879194880194881194882194883194884194885194886194887194888194889194890194891194892194893194894194895194896194897194898194899194900194901194902194903194904194905194906194907194908194909194910194911194912194913194914194915194916194917194918194919194920194921194922194923194924194925194926194927194928194929194930194931194932194933194934194935194936194937194938194939194940194941194942194943194944194945194946194947194948194949194950194951194952194953194954194955194956194957194958194959194960194961194962194963194964194965194966194967194968194969194970194971194972194973194974194975194976194977194978194979194980194981194982194983194984194985194986194987194988194989194990194991194992194993194994194995194996194997194998194999195000195001195002195003195004195005195006195007195008195009195010195011195012195013195014195015195016195017195018195019195020195021195022195023195024195025195026195027195028195029195030195031195032195033195034195035195036195037195038195039195040195041195042195043195044195045195046195047195048195049195050195051195052195053195054195055195056195057195058195059195060195061195062195063195064195065195066195067195068195069195070195071195072195073195074195075195076195077195078195079195080195081195082195083195084195085195086195087195088195089195090195091195092195093195094195095195096195097195098195099195100195101195102195103195104195105195106195107195108195109195110195111195112195113195114195115195116195117195118195119195120195121195122195123195124195125195126195127195128195129195130195131195132195133195134195135195136195137195138195139195140195141195142195143195144195145195146195147195148195149195150195151195152195153195154195155195156195157195158195159195160195161195162195163195164195165195166195167195168195169195170195171195172195173195174195175195176195177195178195179195180195181195182195183195184195185195186195187195188195189195190195191195192195193195194195195195196195197195198195199195200195201195202195203195204195205195206195207195208195209195210195211195212195213195214195215195216195217195218195219195220195221195222195223195224195225195226195227195228195229195230195231195232195233195234195235195236195237195238195239195240195241195242195243195244195245195246195247195248195249195250195251195252195253195254195255195256195257195258195259195260195261195262195263195264195265195266195267195268195269195270195271195272195273195274195275195276195277195278195279195280195281195282195283195284195285195286195287195288195289195290195291195292195293195294195295195296195297195298195299195300195301195302195303195304195305195306195307195308195309195310195311195312195313195314195315195316195317195318195319195320195321195322195323195324195325195326195327195328195329195330195331195332195333195334195335195336195337195338195339195340195341195342195343195344195345195346195347195348195349195350195351195352195353195354195355195356195357195358195359195360195361195362195363195364195365195366195367195368195369195370195371195372195373195374195375195376195377195378195379195380195381195382195383195384195385195386195387195388195389195390195391195392195393195394195395195396195397195398195399195400195401195402195403195404195405195406195407195408195409195410195411195412195413195414195415195416195417195418195419195420195421195422195423195424195425195426195427195428195429195430195431195432195433195434195435195436195437195438195439195440195441195442195443195444195445195446195447195448195449195450195451195452195453195454195455195456195457195458195459195460195461195462195463195464195465195466195467195468195469195470195471195472195473195474195475195476195477195478195479195480195481195482195483195484195485195486195487195488195489195490195491195492195493195494195495195496195497195498195499195500195501195502195503195504195505195506195507195508195509195510195511195512195513195514195515195516195517195518195519195520195521195522195523195524195525195526195527195528195529195530195531195532195533195534195535195536195537195538195539195540195541195542195543195544195545195546195547195548195549195550195551195552195553195554195555195556195557195558195559195560195561195562195563195564195565195566195567195568195569195570195571195572195573195574195575195576195577195578195579195580195581195582195583195584195585195586195587195588195589195590195591195592195593195594195595195596195597195598195599195600195601195602195603195604195605195606195607195608195609195610195611195612195613195614195615195616195617195618195619195620195621195622195623195624195625195626195627195628195629195630195631195632195633195634195635195636195637195638195639195640195641195642195643195644195645195646195647195648195649195650195651195652195653195654195655195656195657195658195659195660195661195662195663195664195665195666195667195668195669195670195671195672195673195674195675195676195677195678195679195680195681195682195683195684195685195686195687195688195689195690195691195692195693195694195695195696195697195698195699195700195701195702195703195704195705195706195707195708195709195710195711195712195713195714195715195716195717195718195719195720195721195722195723195724195725195726195727195728195729195730195731195732195733195734195735195736195737195738195739195740195741195742195743195744195745195746195747195748195749195750195751195752195753195754195755195756195757195758195759195760195761195762195763195764195765195766195767195768195769195770195771195772195773195774195775195776195777195778195779195780195781195782195783195784195785195786195787195788195789195790195791195792195793195794195795195796195797195798195799195800195801195802195803195804195805195806195807195808195809195810195811195812195813195814195815195816195817195818195819195820195821195822195823195824195825195826195827195828195829195830195831195832195833195834195835195836195837195838195839195840195841195842195843195844195845195846195847195848195849195850195851195852195853195854195855195856195857195858195859195860195861195862195863195864195865195866195867195868195869195870195871195872195873195874195875195876195877195878195879195880195881195882195883195884195885195886195887195888195889195890195891195892195893195894195895195896195897195898195899195900195901195902195903195904195905195906195907195908195909195910195911195912195913195914195915195916195917195918195919195920195921195922195923195924195925195926195927195928195929195930195931195932195933195934195935195936195937195938195939195940195941195942195943195944195945195946195947195948195949195950195951195952195953195954195955195956195957195958195959195960195961195962195963195964195965195966195967195968195969195970195971195972195973195974195975195976195977195978195979195980195981195982195983195984195985195986195987195988195989195990195991195992195993195994195995195996195997195998195999196000196001196002196003196004196005196006196007196008196009196010196011196012196013196014196015196016196017196018196019196020196021196022196023196024196025196026196027196028196029196030196031196032196033196034196035196036196037196038196039196040196041196042196043196044196045196046196047196048196049196050196051196052196053196054196055196056196057196058196059196060196061196062196063196064196065196066196067196068196069196070196071196072196073196074196075196076196077196078196079196080196081196082196083196084196085196086196087196088196089196090196091196092196093196094196095196096196097196098196099196100196101196102196103196104196105196106196107196108196109196110196111196112196113196114196115196116196117196118196119196120196121196122196123196124196125196126196127196128196129196130196131196132196133196134196135196136196137196138196139196140196141196142196143196144196145196146196147196148196149196150196151196152196153196154196155196156196157196158196159196160196161196162196163196164196165196166196167196168196169196170196171196172196173196174196175196176196177196178196179196180196181196182196183196184196185196186196187196188196189196190196191196192196193196194196195196196196197196198196199196200196201196202196203196204196205196206196207196208196209196210196211196212196213196214196215196216196217196218196219196220196221196222196223196224196225196226196227196228196229196230196231196232196233196234196235196236196237196238196239196240196241196242196243196244196245196246196247196248196249196250196251196252196253196254196255196256196257196258196259196260196261196262196263196264196265196266196267196268196269196270196271196272196273196274196275196276196277196278196279196280196281196282196283196284196285196286196287196288196289196290196291196292196293196294196295196296196297196298196299196300196301196302196303196304196305196306196307196308196309196310196311196312196313196314196315196316196317196318196319196320196321196322196323196324196325196326196327196328196329196330196331196332196333196334196335196336196337196338196339196340196341196342196343196344196345196346196347196348196349196350196351196352196353196354196355196356196357196358196359196360196361196362196363196364196365196366196367196368196369196370196371196372196373196374196375196376196377196378196379196380196381196382196383196384196385196386196387196388196389196390196391196392196393196394196395196396196397196398196399196400196401196402196403196404196405196406196407196408196409196410196411196412196413196414196415196416196417196418196419196420196421196422196423196424196425196426196427196428196429196430196431196432196433196434196435196436196437196438196439196440196441196442196443196444196445196446196447196448196449196450196451196452196453196454196455196456196457196458196459196460196461196462196463196464196465196466196467196468196469196470196471196472196473196474196475196476196477196478196479196480196481196482196483196484196485196486196487196488196489196490196491196492196493196494196495196496196497196498196499196500196501196502196503196504196505196506196507196508196509196510196511196512196513196514196515196516196517196518196519196520196521196522196523196524196525196526196527196528196529196530196531196532196533196534196535196536196537196538196539196540196541196542196543196544196545196546196547196548196549196550196551196552196553196554196555196556196557196558196559196560196561196562196563196564196565196566196567196568196569196570196571196572196573196574196575196576196577196578196579196580196581196582196583196584196585196586196587196588196589196590196591196592196593196594196595196596196597196598196599196600196601196602196603196604196605196606196607196608196609196610196611196612196613196614196615196616196617196618196619196620196621196622196623196624196625196626196627196628196629196630196631196632196633196634196635196636196637196638196639196640196641196642196643196644196645196646196647196648196649196650196651196652196653196654196655196656196657196658196659196660196661196662196663196664196665196666196667196668196669196670196671196672196673196674196675196676196677196678196679196680196681196682196683196684196685196686196687196688196689196690196691196692196693196694196695196696196697196698196699196700196701196702196703196704196705196706196707196708196709196710196711196712196713196714196715196716196717196718196719196720196721196722196723196724196725196726196727196728196729196730196731196732196733196734196735196736196737196738196739196740196741196742196743196744196745196746196747196748196749196750196751196752196753196754196755196756196757196758196759196760196761196762196763196764196765196766196767196768196769196770196771196772196773196774196775196776196777196778196779196780196781196782196783196784196785196786196787196788196789196790196791196792196793196794196795196796196797196798196799196800196801196802196803196804196805196806196807196808196809196810196811196812196813196814196815196816196817196818196819196820196821196822196823196824196825196826196827196828196829196830196831196832196833196834196835196836196837196838196839196840196841196842196843196844196845196846196847196848196849196850196851196852196853196854196855196856196857196858196859196860196861196862196863196864196865196866196867196868196869196870196871196872196873196874196875196876196877196878196879196880196881196882196883196884196885196886196887196888196889196890196891196892196893196894196895196896196897196898196899196900196901196902196903196904196905196906196907196908196909196910196911196912196913196914196915196916196917196918196919196920196921196922196923196924196925196926196927196928196929196930196931196932196933196934196935196936196937196938196939196940196941196942196943196944196945196946196947196948196949196950196951196952196953196954196955196956196957196958196959196960196961196962196963196964196965196966196967196968196969196970196971196972196973196974196975196976196977196978196979196980196981196982196983196984196985196986196987196988196989196990196991196992196993196994196995196996196997196998196999197000197001197002197003197004197005197006197007197008197009197010197011197012197013197014197015197016197017197018197019197020197021197022197023197024197025197026197027197028197029197030197031197032197033197034197035197036197037197038197039197040197041197042197043197044197045197046197047197048197049197050197051197052197053197054197055197056197057197058197059197060197061197062197063197064197065197066197067197068197069197070197071197072197073197074197075197076197077197078197079197080197081197082197083197084197085197086197087197088197089197090197091197092197093197094197095197096197097197098197099197100197101197102197103197104197105197106197107197108197109197110197111197112197113197114197115197116197117197118197119197120197121197122197123197124197125197126197127197128197129197130197131197132197133197134197135197136197137197138197139197140197141197142197143197144197145197146197147197148197149197150197151197152197153197154197155197156197157197158197159197160197161197162197163197164197165197166197167197168197169197170197171197172197173197174197175197176197177197178197179197180197181197182197183197184197185197186197187197188197189197190197191197192197193197194197195197196197197197198197199197200197201197202197203197204197205197206197207197208197209197210197211197212197213197214197215197216197217197218197219197220197221197222197223197224197225197226197227197228197229197230197231197232197233197234197235197236197237197238197239197240197241197242197243197244197245197246197247197248197249197250197251197252197253197254197255197256197257197258197259197260197261197262197263197264197265197266197267197268197269197270197271197272197273197274197275197276197277197278197279197280197281197282197283197284197285197286197287197288197289197290197291197292197293197294197295197296197297197298197299197300197301197302197303197304197305197306197307197308197309197310197311197312197313197314197315197316197317197318197319197320197321197322197323197324197325197326197327197328197329197330197331197332197333197334197335197336197337197338197339197340197341197342197343197344197345197346197347197348197349197350197351197352197353197354197355197356197357197358197359197360197361197362197363197364197365197366197367197368197369197370197371197372197373197374197375197376197377197378197379197380197381197382197383197384197385197386197387197388197389197390197391197392197393197394197395197396197397197398197399197400197401197402197403197404197405197406197407197408197409197410197411197412197413197414197415197416197417197418197419197420197421197422197423197424197425197426197427197428197429197430197431197432197433197434197435197436197437197438197439197440197441197442197443197444197445197446197447197448197449197450197451197452197453197454197455197456197457197458197459197460197461197462197463197464197465197466197467197468197469197470197471197472197473197474197475197476197477197478197479197480197481197482197483197484197485197486197487197488197489197490197491197492197493197494197495197496197497197498197499197500197501197502197503197504197505197506197507197508197509197510197511197512197513197514197515197516197517197518197519197520197521197522197523197524197525197526197527197528197529197530197531197532197533197534197535197536197537197538197539197540197541197542197543197544197545197546197547197548197549197550197551197552197553197554197555197556197557197558197559197560197561197562197563197564197565197566197567197568197569197570197571197572197573197574197575197576197577197578197579197580197581197582197583197584197585197586197587197588197589197590197591197592197593197594197595197596197597197598197599197600197601197602197603197604197605197606197607197608197609197610197611197612197613197614197615197616197617197618197619197620197621197622197623197624197625197626197627197628197629197630197631197632197633197634197635197636197637197638197639197640197641197642197643197644197645197646197647197648197649197650197651197652197653197654197655197656197657197658197659197660197661197662197663197664197665197666197667197668197669197670197671197672197673197674197675197676197677197678197679197680197681197682197683197684197685197686197687197688197689197690197691197692197693197694197695197696197697197698197699197700197701197702197703197704197705197706197707197708197709197710197711197712197713197714197715197716197717197718197719197720197721197722197723197724197725197726197727197728197729197730197731197732197733197734197735197736197737197738197739197740197741197742197743197744197745197746197747197748197749197750197751197752197753197754197755197756197757197758197759197760197761197762197763197764197765197766197767197768197769197770197771197772197773197774197775197776197777197778197779197780197781197782197783197784197785197786197787197788197789197790197791197792197793197794197795197796197797197798197799197800197801197802197803197804197805197806197807197808197809197810197811197812197813197814197815197816197817197818197819197820197821197822197823197824197825197826197827197828197829197830197831197832197833197834197835197836197837197838197839197840197841197842197843197844197845197846197847197848197849197850197851197852197853197854197855197856197857197858197859197860197861197862197863197864197865197866197867197868197869197870197871197872197873197874197875197876197877197878197879197880197881197882197883197884197885197886197887197888197889197890197891197892197893197894197895197896197897197898197899197900197901197902197903197904197905197906197907197908197909197910197911197912197913197914197915197916197917197918197919197920197921197922197923197924197925197926197927197928197929197930197931197932197933197934197935197936197937197938197939197940197941197942197943197944197945197946197947197948197949197950197951197952197953197954197955197956197957197958197959197960197961197962197963197964197965197966197967197968197969197970197971197972197973197974197975197976197977197978197979197980197981197982197983197984197985197986197987197988197989197990197991197992197993197994197995197996197997197998197999198000198001198002198003198004198005198006198007198008198009198010198011198012198013198014198015198016198017198018198019198020198021198022198023198024198025198026198027198028198029198030198031198032198033198034198035198036198037198038198039198040198041198042198043198044198045198046198047198048198049198050198051198052198053198054198055198056198057198058198059198060198061198062198063198064198065198066198067198068198069198070198071198072198073198074198075198076198077198078198079198080198081198082198083198084198085198086198087198088198089198090198091198092198093198094198095198096198097198098198099198100198101198102198103198104198105198106198107198108198109198110198111198112198113198114198115198116198117198118198119198120198121198122198123198124198125198126198127198128198129198130198131198132198133198134198135198136198137198138198139198140198141198142198143198144198145198146198147198148198149198150198151198152198153198154198155198156198157198158198159198160198161198162198163198164198165198166198167198168198169198170198171198172198173198174198175198176198177198178198179198180198181198182198183198184198185198186198187198188198189198190198191198192198193198194198195198196198197198198198199198200198201198202198203198204198205198206198207198208198209198210198211198212198213198214198215198216198217198218198219198220198221198222198223198224198225198226198227198228198229198230198231198232198233198234198235198236198237198238198239198240198241198242198243198244198245198246198247198248198249198250198251198252198253198254198255198256198257198258198259198260198261198262198263198264198265198266198267198268198269198270198271198272198273198274198275198276198277198278198279198280198281198282198283198284198285198286198287198288198289198290198291198292198293198294198295198296198297198298198299198300198301198302198303198304198305198306198307198308198309198310198311198312198313198314198315198316198317198318198319198320198321198322198323198324198325198326198327198328198329198330198331198332198333198334198335198336198337198338198339198340198341198342198343198344198345198346198347198348198349198350198351198352198353198354198355198356198357198358198359198360198361198362198363198364198365198366198367198368198369198370198371198372198373198374198375198376198377198378198379198380198381198382198383198384198385198386198387198388198389198390198391198392198393198394198395198396198397198398198399198400198401198402198403198404198405198406198407198408198409198410198411198412198413198414198415198416198417198418198419198420198421198422198423198424198425198426198427198428198429198430198431198432198433198434198435198436198437198438198439198440198441198442198443198444198445198446198447198448198449198450198451198452198453198454198455198456198457198458198459198460198461198462198463198464198465198466198467198468198469198470198471198472198473198474198475198476198477198478198479198480198481198482198483198484198485198486198487198488198489198490198491198492198493198494198495198496198497198498198499198500198501198502198503198504198505198506198507198508198509198510198511198512198513198514198515198516198517198518198519198520198521198522198523198524198525198526198527198528198529198530198531198532198533198534198535198536198537198538198539198540198541198542198543198544198545198546198547198548198549198550198551198552198553198554198555198556198557198558198559198560198561198562198563198564198565198566198567198568198569198570198571198572198573198574198575198576198577198578198579198580198581198582198583198584198585198586198587198588198589198590198591198592198593198594198595198596198597198598198599198600198601198602198603198604198605198606198607198608198609198610198611198612198613198614198615198616198617198618198619198620198621198622198623198624198625198626198627198628198629198630198631198632198633198634198635198636198637198638198639198640198641198642198643198644198645198646198647198648198649198650198651198652198653198654198655198656198657198658198659198660198661198662198663198664198665198666198667198668198669198670198671198672198673198674198675198676198677198678198679198680198681198682198683198684198685198686198687198688198689198690198691198692198693198694198695198696198697198698198699198700198701198702198703198704198705198706198707198708198709198710198711198712198713198714198715198716198717198718198719198720198721198722198723198724198725198726198727198728198729198730198731198732198733198734198735198736198737198738198739198740198741198742198743198744198745198746198747198748198749198750198751198752198753198754198755198756198757198758198759198760198761198762198763198764198765198766198767198768198769198770198771198772198773198774198775198776198777198778198779198780198781198782198783198784198785198786198787198788198789198790198791198792198793198794198795198796198797198798198799198800198801198802198803198804198805198806198807198808198809198810198811198812198813198814198815198816198817198818198819198820198821198822198823198824198825198826198827198828198829198830198831198832198833198834198835198836198837198838198839198840198841198842198843198844198845198846198847198848198849198850198851198852198853198854198855198856198857198858198859198860198861198862198863198864198865198866198867198868198869198870198871198872198873198874198875198876198877198878198879198880198881198882198883198884198885198886198887198888198889198890198891198892198893198894198895198896198897198898198899198900198901198902198903198904198905198906198907198908198909198910198911198912198913198914198915198916198917198918198919198920198921198922198923198924198925198926198927198928198929198930198931198932198933198934198935198936198937198938198939198940198941198942198943198944198945198946198947198948198949198950198951198952198953198954198955198956198957198958198959198960198961198962198963198964198965198966198967198968198969198970198971198972198973198974198975198976198977198978198979198980198981198982198983198984198985198986198987198988198989198990198991198992198993198994198995198996198997198998198999199000199001199002199003199004199005199006199007199008199009199010199011199012199013199014199015199016199017199018199019199020199021199022199023199024199025199026199027199028199029199030199031199032199033199034199035199036199037199038199039199040199041199042199043199044199045199046199047199048199049199050199051199052199053199054199055199056199057199058199059199060199061199062199063199064199065199066199067199068199069199070199071199072199073199074199075199076199077199078199079199080199081199082199083199084199085199086199087199088199089199090199091199092199093199094199095199096199097199098199099199100199101199102199103199104199105199106199107199108199109199110199111199112199113199114199115199116199117199118199119199120199121199122199123199124199125199126199127199128199129199130199131199132199133199134199135199136199137199138199139199140199141199142199143199144199145199146199147199148199149199150199151199152199153199154199155199156199157199158199159199160199161199162199163199164199165199166199167199168199169199170199171199172199173199174199175199176199177199178199179199180199181199182199183199184199185199186199187199188199189199190199191199192199193199194199195199196199197199198199199199200199201199202199203199204199205199206199207199208199209199210199211199212199213199214199215199216199217199218199219199220199221199222199223199224199225199226199227199228199229199230199231199232199233199234199235199236199237199238199239199240199241199242199243199244199245199246199247199248199249199250199251199252199253199254199255199256199257199258199259199260199261199262199263199264199265199266199267199268199269199270199271199272199273199274199275199276199277199278199279199280199281199282199283199284199285199286199287199288199289199290199291199292199293199294199295199296199297199298199299199300199301199302199303199304199305199306199307199308199309199310199311199312199313199314199315199316199317199318199319199320199321199322199323199324199325199326199327199328199329199330199331199332199333199334199335199336199337199338199339199340199341199342199343199344199345199346199347199348199349199350199351199352199353199354199355199356199357199358199359199360199361199362199363199364199365199366199367199368199369199370199371199372199373199374199375199376199377199378199379199380199381199382199383199384199385199386199387199388199389199390199391199392199393199394199395199396199397199398199399199400199401199402199403199404199405199406199407199408199409199410199411199412199413199414199415199416199417199418199419199420199421199422199423199424199425199426199427199428199429199430199431199432199433199434199435199436199437199438199439199440199441199442199443199444199445199446199447199448199449199450199451199452199453199454199455199456199457199458199459199460199461199462199463199464199465199466199467199468199469199470199471199472199473199474199475199476199477199478199479199480199481199482199483199484199485199486199487199488199489199490199491199492199493199494199495199496199497199498199499199500199501199502199503199504199505199506199507199508199509199510199511199512199513199514199515199516199517199518199519199520199521199522199523199524199525199526199527199528199529199530199531199532199533199534199535199536199537199538199539199540199541199542199543199544199545199546199547199548199549199550199551199552199553199554199555199556199557199558199559199560199561199562199563199564199565199566199567199568199569199570199571199572199573199574199575199576199577199578199579199580199581199582199583199584199585199586199587199588199589199590199591199592199593199594199595199596199597199598199599199600199601199602199603199604199605199606199607199608199609199610199611199612199613199614199615199616199617199618199619199620199621199622199623199624199625199626199627199628199629199630199631199632199633199634199635199636199637199638199639199640199641199642199643199644199645199646199647199648199649199650199651199652199653199654199655199656199657199658199659199660199661199662199663199664199665199666199667199668199669199670199671199672199673199674199675199676199677199678199679199680199681199682199683199684199685199686199687199688199689199690199691199692199693199694199695199696199697199698199699199700199701199702199703199704199705199706199707199708199709199710199711199712199713199714199715199716199717199718199719199720199721199722199723199724199725199726199727199728199729199730199731199732199733199734199735199736199737199738199739199740199741199742199743199744199745199746199747199748199749199750199751199752199753199754199755199756199757199758199759199760199761199762199763199764199765199766199767199768199769199770199771199772199773199774199775199776199777199778199779199780199781199782199783199784199785199786199787199788199789199790199791199792199793199794199795199796199797199798199799199800199801199802199803199804199805199806199807199808199809199810199811199812199813199814199815199816199817199818199819199820199821199822199823199824199825199826199827199828199829199830199831199832199833199834199835199836199837199838199839199840199841199842199843199844199845199846199847199848199849199850199851199852199853199854199855199856199857199858199859199860199861199862199863199864199865199866199867199868199869199870199871199872199873199874199875199876199877199878199879199880199881199882199883199884199885199886199887199888199889199890199891199892199893199894199895199896199897199898199899199900199901199902199903199904199905199906199907199908199909199910199911199912199913199914199915199916199917199918199919199920199921199922199923199924199925199926199927199928199929199930199931199932199933199934199935199936199937199938199939199940199941199942199943199944199945199946199947199948199949199950199951199952199953199954199955199956199957199958199959199960199961199962199963199964199965199966199967199968199969199970199971199972199973199974199975199976199977199978199979199980199981199982199983199984199985199986199987199988199989199990199991199992199993199994199995199996199997199998199999200000200001200002200003200004200005200006200007200008200009200010200011200012200013200014200015200016200017200018200019200020200021200022200023200024200025200026200027200028200029200030200031200032200033200034200035200036200037200038200039200040200041200042200043200044200045200046200047200048200049200050200051200052200053200054200055200056200057200058200059200060200061200062200063200064200065200066200067200068200069200070200071200072200073200074200075200076200077200078200079200080200081200082200083200084200085200086200087200088200089200090200091200092200093200094200095200096200097200098200099200100200101200102200103200104200105200106200107200108200109200110200111200112200113200114200115200116200117200118200119200120200121200122200123200124200125200126200127200128200129200130200131200132200133200134200135200136200137200138200139200140200141200142200143200144200145200146200147200148200149200150200151200152200153200154200155200156200157200158200159200160200161200162200163200164200165200166200167200168200169200170200171200172200173200174200175200176200177200178200179200180200181200182200183200184200185200186200187200188200189200190200191200192200193200194200195200196200197200198200199200200200201200202200203200204200205200206200207200208200209200210200211200212200213200214200215200216200217200218200219200220200221200222200223200224200225200226200227200228200229200230200231200232200233200234200235200236200237200238200239200240200241200242200243200244200245200246200247200248200249200250200251200252200253200254200255200256200257200258200259200260200261200262200263200264200265200266200267200268200269200270200271200272200273200274200275200276200277200278200279200280200281200282200283200284200285200286200287200288200289200290200291200292200293200294200295200296200297200298200299200300200301200302200303200304200305200306200307200308200309200310200311200312200313200314200315200316200317200318200319200320200321200322200323200324200325200326200327200328200329200330200331200332200333200334200335200336200337200338200339200340200341200342200343200344200345200346200347200348200349200350200351200352200353200354200355200356200357200358200359200360200361200362200363200364200365200366200367200368200369200370200371200372200373200374200375200376200377200378200379200380200381200382200383200384200385200386200387200388200389200390200391200392200393200394200395200396200397200398200399200400200401200402200403200404200405200406200407200408200409200410200411200412200413200414200415200416200417200418200419200420200421200422200423200424200425200426200427200428200429200430200431200432200433200434200435200436200437200438200439200440200441200442200443200444200445200446200447200448200449200450200451200452200453200454200455200456200457200458200459200460200461200462200463200464200465200466200467200468200469200470200471200472200473200474200475200476200477200478200479200480200481200482200483200484200485200486200487200488200489200490200491200492200493200494200495200496200497200498200499200500200501200502200503200504200505200506200507200508200509200510200511200512200513200514200515200516200517200518200519200520200521200522200523200524200525200526200527200528200529200530200531200532200533200534200535200536200537200538200539200540200541200542200543200544200545200546200547200548200549200550200551200552200553200554200555200556200557200558200559200560200561200562200563200564200565200566200567200568200569200570200571200572200573200574200575200576200577200578200579200580200581200582200583200584200585200586200587200588200589200590200591200592200593200594200595200596200597200598200599200600200601200602200603200604200605200606200607200608200609200610200611200612200613200614200615200616200617200618200619200620200621200622200623200624200625200626200627200628200629200630200631200632200633200634200635200636200637200638200639200640200641200642200643200644200645200646200647200648200649200650200651200652200653200654200655200656200657200658200659200660200661200662200663200664200665200666200667200668200669200670200671200672200673200674200675200676200677200678200679200680200681200682200683200684200685200686200687200688200689200690200691200692200693200694200695200696200697200698200699200700200701200702200703200704200705200706200707200708200709200710200711200712200713200714200715200716200717200718200719200720200721200722200723200724200725200726200727200728200729200730200731200732200733200734200735200736200737200738200739200740200741200742200743200744200745200746200747200748200749200750200751200752200753200754200755200756200757200758200759200760200761200762200763200764200765200766200767200768200769200770200771200772200773200774200775200776200777200778200779200780200781200782200783200784200785200786200787200788200789200790200791200792200793200794200795200796200797200798200799200800200801200802200803200804200805200806200807200808200809200810200811200812200813200814200815200816200817200818200819200820200821200822200823200824200825200826200827200828200829200830200831200832200833200834200835200836200837200838200839200840200841200842200843200844200845200846200847200848200849200850200851200852200853200854200855200856200857200858200859200860200861200862200863200864200865200866200867200868200869200870200871200872200873200874200875200876200877200878200879200880200881200882200883200884200885200886200887200888200889200890200891200892200893200894200895200896200897200898200899200900200901200902200903200904200905200906200907200908200909200910200911200912200913200914200915200916200917200918200919200920200921200922200923200924200925200926200927200928200929200930200931200932200933200934200935200936200937200938200939200940200941200942200943200944200945200946200947200948200949200950200951200952200953200954200955200956200957200958200959200960200961200962200963200964200965200966200967200968200969200970200971200972200973200974200975200976200977200978200979200980200981200982200983200984200985200986200987200988200989200990200991200992200993200994200995200996200997200998200999201000201001201002201003201004201005201006201007201008201009201010201011201012201013201014201015201016201017201018201019201020201021201022201023201024201025201026201027201028201029201030201031201032201033201034201035201036201037201038201039201040201041201042201043201044201045201046201047201048201049201050201051201052201053201054201055201056201057201058201059201060201061201062201063201064201065201066201067201068201069201070201071201072201073201074201075201076201077201078201079201080201081201082201083201084201085201086201087201088201089201090201091201092201093201094201095201096201097201098201099201100201101201102201103201104201105201106201107201108201109201110201111201112201113201114201115201116201117201118201119201120201121201122201123201124201125201126201127201128201129201130201131201132201133201134201135201136201137201138201139201140201141201142201143201144201145201146201147201148201149201150201151201152201153201154201155201156201157201158201159201160201161201162201163201164201165201166201167201168201169201170201171201172201173201174201175201176201177201178201179201180201181201182201183201184201185201186201187201188201189201190201191201192201193201194201195201196201197201198201199201200201201201202201203201204201205201206201207201208201209201210201211201212201213201214201215201216201217201218201219201220201221201222201223201224201225201226201227201228201229201230201231201232201233201234201235201236201237201238201239201240201241201242201243201244201245201246201247201248201249201250201251201252201253201254201255201256201257201258201259201260201261201262201263201264201265201266201267201268201269201270201271201272201273201274201275201276201277201278201279201280201281201282201283201284201285201286201287201288201289201290201291201292201293201294201295201296201297201298201299201300201301201302201303201304201305201306201307201308201309201310201311201312201313201314201315201316201317201318201319201320201321201322201323201324201325201326201327201328201329201330201331201332201333201334201335201336201337201338201339201340201341201342201343201344201345201346201347201348201349201350201351201352201353201354201355201356201357201358201359201360201361201362201363201364201365201366201367201368201369201370201371201372201373201374201375201376201377201378201379201380201381201382201383201384201385201386201387201388201389201390201391201392201393201394201395201396201397201398201399201400201401201402201403201404201405201406201407201408201409201410201411201412201413201414201415201416201417201418201419201420201421201422201423201424201425201426201427201428201429201430201431201432201433201434201435201436201437201438201439201440201441201442201443201444201445201446201447201448201449201450201451201452201453201454201455201456201457201458201459201460201461201462201463201464201465201466201467201468201469201470201471201472201473201474201475201476201477201478201479201480201481201482201483201484201485201486201487201488201489201490201491201492201493201494201495201496201497201498201499201500201501201502201503201504201505201506201507201508201509201510201511201512201513201514201515201516201517201518201519201520201521201522201523201524201525201526201527201528201529201530201531201532201533201534201535201536201537201538201539201540201541201542201543201544201545201546201547201548201549201550201551201552201553201554201555201556201557201558201559201560201561201562201563201564201565201566201567201568201569201570201571201572201573201574201575201576201577201578201579201580201581201582201583201584201585201586201587201588201589201590201591201592201593201594201595201596201597201598201599201600201601201602201603201604201605201606201607201608201609201610201611201612201613201614201615201616201617201618201619201620201621201622201623201624201625201626201627201628201629201630201631201632201633201634201635201636201637201638201639201640201641201642201643201644201645201646201647201648201649201650201651201652201653201654201655201656201657201658201659201660201661201662201663201664201665201666201667201668201669201670201671201672201673201674201675201676201677201678201679201680201681201682201683201684201685201686201687201688201689201690201691201692201693201694201695201696201697201698201699201700201701201702201703201704201705201706201707201708201709201710201711201712201713201714201715201716201717201718201719201720201721201722201723201724201725201726201727201728201729201730201731201732201733201734201735201736201737201738201739201740201741201742201743201744201745201746201747201748201749201750201751201752201753201754201755201756201757201758201759201760201761201762201763201764201765201766201767201768201769201770201771201772201773201774201775201776201777201778201779201780201781201782201783201784201785201786201787201788201789201790201791201792201793201794201795201796201797201798201799201800201801201802201803201804201805201806201807201808201809201810201811201812201813201814201815201816201817201818201819201820201821201822201823201824201825201826201827201828201829201830201831201832201833201834201835201836201837201838201839201840201841201842201843201844201845201846201847201848201849201850201851201852201853201854201855201856201857201858201859201860201861201862201863201864201865201866201867201868201869201870201871201872201873201874201875201876201877201878201879201880201881201882201883201884201885201886201887201888201889201890201891201892201893201894201895201896201897201898201899201900201901201902201903201904201905201906201907201908201909201910201911201912201913201914201915201916201917201918201919201920201921201922201923201924201925201926201927201928201929201930201931201932201933201934201935201936201937201938201939201940201941201942201943201944201945201946201947201948201949201950201951201952201953201954201955201956201957201958201959201960201961201962201963201964201965201966201967201968201969201970201971201972201973201974201975201976201977201978201979201980201981201982201983201984201985201986201987201988201989201990201991201992201993201994201995201996201997201998201999202000202001202002202003202004202005202006202007202008202009202010202011202012202013202014202015202016202017202018202019202020202021202022202023202024202025202026202027202028202029202030202031202032202033202034202035202036202037202038202039202040202041202042202043202044202045202046202047202048202049202050202051202052202053202054202055202056202057202058202059202060202061202062202063202064202065202066202067202068202069202070202071202072202073202074202075202076202077202078202079202080202081202082202083202084202085202086202087202088202089202090202091202092202093202094202095202096202097202098202099202100202101202102202103202104202105202106202107202108202109202110202111202112202113202114202115202116202117202118202119202120202121202122202123202124202125202126202127202128202129202130202131202132202133202134202135202136202137202138202139202140202141202142202143202144202145202146202147202148202149202150202151202152202153202154202155202156202157202158202159202160202161202162202163202164202165202166202167202168202169202170202171202172202173202174202175202176202177202178202179202180202181202182202183202184202185202186202187202188202189202190202191202192202193202194202195202196202197202198202199202200202201202202202203202204202205202206202207202208202209202210202211202212202213202214202215202216202217202218202219202220202221202222202223202224202225202226202227202228202229202230202231202232202233202234202235202236202237202238202239202240202241202242202243202244202245202246202247202248202249202250202251202252202253202254202255202256202257202258202259202260202261202262202263202264202265202266202267202268202269202270202271202272202273202274202275202276202277202278202279202280202281202282202283202284202285202286202287202288202289202290202291202292202293202294202295202296202297202298202299202300202301202302202303202304202305202306202307202308202309202310202311202312202313202314202315202316202317202318202319202320202321202322202323202324202325202326202327202328202329202330202331202332202333202334202335202336202337202338202339202340202341202342202343202344202345202346202347202348202349202350202351202352202353202354202355202356202357202358202359202360202361202362202363202364202365202366202367202368202369202370202371202372202373202374202375202376202377202378202379202380202381202382202383202384202385202386202387202388202389202390202391202392202393202394202395202396202397202398202399202400202401202402202403202404202405202406202407202408202409202410202411202412202413202414202415202416202417202418202419202420202421202422202423202424202425202426202427202428202429202430202431202432202433202434202435202436202437202438202439202440202441202442202443202444202445202446202447202448202449202450202451202452202453202454202455202456202457202458202459202460202461202462202463202464202465202466202467202468202469202470202471202472202473202474202475202476202477202478202479202480202481202482202483202484202485202486202487202488202489202490202491202492202493202494202495202496202497202498202499202500202501202502202503202504202505202506202507202508202509202510202511202512202513202514202515202516202517202518202519202520202521202522202523202524202525202526202527202528202529202530202531202532202533202534202535202536202537202538202539202540202541202542202543202544202545202546202547202548202549202550202551202552202553202554202555202556202557202558202559202560202561202562202563202564202565202566202567202568202569202570202571202572202573202574202575202576202577202578202579202580202581202582202583202584202585202586202587202588202589202590202591202592202593202594202595202596202597202598202599202600202601202602202603202604202605202606202607202608202609202610202611202612202613202614202615202616202617202618202619202620202621202622202623202624202625202626202627202628202629202630202631202632202633202634202635202636202637202638202639202640202641202642202643202644202645202646202647202648202649202650202651202652202653202654202655202656202657202658202659202660202661202662202663202664202665202666202667202668202669202670202671202672202673202674202675202676202677202678202679202680202681202682202683202684202685202686202687202688202689202690202691202692202693202694202695202696202697202698202699202700202701202702202703202704202705202706202707202708202709202710202711202712202713202714202715202716202717202718202719202720202721202722202723202724202725202726202727202728202729202730202731202732202733202734202735202736202737202738202739202740202741202742202743202744202745202746202747202748202749202750202751202752202753202754202755202756202757202758202759202760202761202762202763202764202765202766202767202768202769202770202771202772202773202774202775202776202777202778202779202780202781202782202783202784202785202786202787202788202789202790202791202792202793202794202795202796202797202798202799202800202801202802202803202804202805202806202807202808202809202810202811202812202813202814202815202816202817202818202819202820202821202822202823202824202825202826202827202828202829202830202831202832202833202834202835202836202837202838202839202840202841202842202843202844202845202846202847202848202849202850202851202852202853202854202855202856202857202858202859202860202861202862202863202864202865202866202867202868202869202870202871202872202873202874202875202876202877202878202879202880202881202882202883202884202885202886202887202888202889202890202891202892202893202894202895202896202897202898202899202900202901202902202903202904202905202906202907202908202909202910202911202912202913202914202915202916202917202918202919202920202921202922202923202924202925202926202927202928202929202930202931202932202933202934202935202936202937202938202939202940202941202942202943202944202945202946202947202948202949202950202951202952202953202954202955202956202957202958202959202960202961202962202963202964202965202966202967202968202969202970202971202972202973202974202975202976202977202978202979202980202981202982202983202984202985202986202987202988202989202990202991202992202993202994202995202996202997202998202999203000203001203002203003203004203005203006203007203008203009203010203011203012203013203014203015203016203017203018203019203020203021203022203023203024203025203026203027203028203029203030203031203032203033203034203035203036203037203038203039203040203041203042203043203044203045203046203047203048203049203050203051203052203053203054203055203056203057203058203059203060203061203062203063203064203065203066203067203068203069203070203071203072203073203074203075203076203077203078203079203080203081203082203083203084203085203086203087203088203089203090203091203092203093203094203095203096203097203098203099203100203101203102203103203104203105203106203107203108203109203110203111203112203113203114203115203116203117203118203119203120203121203122203123203124203125203126203127203128203129203130203131203132203133203134203135203136203137203138203139203140203141203142203143203144203145203146203147203148203149203150203151203152203153203154203155203156203157203158203159203160203161203162203163203164203165203166203167203168203169203170203171203172203173203174203175203176203177203178203179203180203181203182203183203184203185203186203187203188203189203190203191203192203193203194203195203196203197203198203199203200203201203202203203203204203205203206203207203208203209203210203211203212203213203214203215203216203217203218203219203220203221203222203223203224203225203226203227203228203229203230203231203232203233203234203235203236203237203238203239203240203241203242203243203244203245203246203247203248203249203250203251203252203253203254203255203256203257203258203259203260203261203262203263203264203265203266203267203268203269203270203271203272203273203274203275203276203277203278203279203280203281203282203283203284203285203286203287203288203289203290203291203292203293203294203295203296203297203298203299203300203301203302203303203304203305203306203307203308203309203310203311203312203313203314203315203316203317203318203319203320203321203322203323203324203325203326203327203328203329203330203331203332203333203334203335203336203337203338203339203340203341203342203343203344203345203346203347203348203349203350203351203352203353203354203355203356203357203358203359203360203361203362203363203364203365203366203367203368203369203370203371203372203373203374203375203376203377203378203379203380203381203382203383203384203385203386203387203388203389203390203391203392203393203394203395203396203397203398203399203400203401203402203403203404203405203406203407203408203409203410203411203412203413203414203415203416203417203418203419203420203421203422203423203424203425203426203427203428203429203430203431203432203433203434203435203436203437203438203439203440203441203442203443203444203445203446203447203448203449203450203451203452203453203454203455203456203457203458203459203460203461203462203463203464203465203466203467203468203469203470203471203472203473203474203475203476203477203478203479203480203481203482203483203484203485203486203487203488203489203490203491203492203493203494203495203496203497203498203499203500203501203502203503203504203505203506203507203508203509203510203511203512203513203514203515203516203517203518203519203520203521203522203523203524203525203526203527203528203529203530203531203532203533203534203535203536203537203538203539203540203541203542203543203544203545203546203547203548203549203550203551203552203553203554203555203556203557203558203559203560203561203562203563203564203565203566203567203568203569203570203571203572203573203574203575203576203577203578203579203580203581203582203583203584203585203586203587203588203589203590203591203592203593203594203595203596203597203598203599203600203601203602203603203604203605203606203607203608203609203610203611203612203613203614203615203616203617203618203619203620203621203622203623203624203625203626203627203628203629203630203631203632203633203634203635203636203637203638203639203640203641203642203643203644203645203646203647203648203649203650203651203652203653203654203655203656203657203658203659203660203661203662203663203664203665203666203667203668203669203670203671203672203673203674203675203676203677203678203679203680203681203682203683203684203685203686203687203688203689203690203691203692203693203694203695203696203697203698203699203700203701203702203703203704203705203706203707203708203709203710203711203712203713203714203715203716203717203718203719203720203721203722203723203724203725203726203727203728203729203730203731203732203733203734203735203736203737203738203739203740203741203742203743203744203745203746203747203748203749203750203751203752203753203754203755203756203757203758203759203760203761203762203763203764203765203766203767203768203769203770203771203772203773203774203775203776203777203778203779203780203781203782203783203784203785203786203787203788203789203790203791203792203793203794203795203796203797203798203799203800203801203802203803203804203805203806203807203808203809203810203811203812203813203814203815203816203817203818203819203820203821203822203823203824203825203826203827203828203829203830203831203832203833203834203835203836203837203838203839203840203841203842203843203844203845203846203847203848203849203850203851203852203853203854203855203856203857203858203859203860203861203862203863203864203865203866203867203868203869203870203871203872203873203874203875203876203877203878203879203880203881203882203883203884203885203886203887203888203889203890203891203892203893203894203895203896203897203898203899203900203901203902203903203904203905203906203907203908203909203910203911203912203913203914203915203916203917203918203919203920203921203922203923203924203925203926203927203928203929203930203931203932203933203934203935203936203937203938203939203940203941203942203943203944203945203946203947203948203949203950203951203952203953203954203955203956203957203958203959203960203961203962203963203964203965203966203967203968203969203970203971203972203973203974203975203976203977203978203979203980203981203982203983203984203985203986203987203988203989203990203991203992203993203994203995203996203997203998203999204000204001204002204003204004204005204006204007204008204009204010204011204012204013204014204015204016204017204018204019204020204021204022204023204024204025204026204027204028204029204030204031204032204033204034204035204036204037204038204039204040204041204042204043204044204045204046204047204048204049204050204051204052204053204054204055204056204057204058204059204060204061204062204063204064204065204066204067204068204069204070204071204072204073204074204075204076204077204078204079204080204081204082204083204084204085204086204087204088204089204090204091204092204093204094204095204096204097204098204099204100204101204102204103204104204105204106204107204108204109204110204111204112204113204114204115204116204117204118204119204120204121204122204123204124204125204126204127204128204129204130204131204132204133204134204135204136204137204138204139204140204141204142204143204144204145204146204147204148204149204150204151204152204153204154204155204156204157204158204159204160204161204162204163204164204165204166204167204168204169204170204171204172204173204174204175204176204177204178204179204180204181204182204183204184204185204186204187204188204189204190204191204192204193204194204195204196204197204198204199204200204201204202204203204204204205204206204207204208204209204210204211204212204213204214204215204216204217204218204219204220204221204222204223204224204225204226204227204228204229204230204231204232204233204234204235204236204237204238204239204240204241204242204243204244204245204246204247204248204249204250204251204252204253204254204255204256204257204258204259204260204261204262204263204264204265204266204267204268204269204270204271204272204273204274204275204276204277204278204279204280204281204282204283204284204285204286204287204288204289204290204291204292204293204294204295204296204297204298204299204300204301204302204303204304204305204306204307204308204309204310204311204312204313204314204315204316204317204318204319204320204321204322204323204324204325204326204327204328204329204330204331204332204333204334204335204336204337204338204339204340204341204342204343204344204345204346204347204348204349204350204351204352204353204354204355204356204357204358204359204360204361204362204363204364204365204366204367204368204369204370204371204372204373204374204375204376204377204378204379204380204381204382204383204384204385204386204387204388204389204390204391204392204393204394204395204396204397204398204399204400204401204402204403204404204405204406204407204408204409204410204411204412204413204414204415204416204417204418204419204420204421204422204423204424204425204426204427204428204429204430204431204432204433204434204435204436204437204438204439204440204441204442204443204444204445204446204447204448204449204450204451204452204453204454204455204456204457204458204459204460204461204462204463204464204465204466204467204468204469204470204471204472204473204474204475204476204477204478204479204480204481204482204483204484204485204486204487204488204489204490204491204492204493204494204495204496204497204498204499204500204501204502204503204504204505204506204507204508204509204510204511204512204513204514204515204516204517204518204519204520204521204522204523204524204525204526204527204528204529204530204531204532204533204534204535204536204537204538204539204540204541204542204543204544204545204546204547204548204549204550204551204552204553204554204555204556204557204558204559204560204561204562204563204564204565204566204567204568204569204570204571204572204573204574204575204576204577204578204579204580204581204582204583204584204585204586204587204588204589204590204591204592204593204594204595204596204597204598204599204600204601204602204603204604204605204606204607204608204609204610204611204612204613204614204615204616204617204618204619204620204621204622204623204624204625204626204627204628204629204630204631204632204633204634204635204636204637204638204639204640204641204642204643204644204645204646204647204648204649204650204651204652204653204654204655204656204657204658204659204660204661204662204663204664204665204666204667204668204669204670204671204672204673204674204675204676204677204678204679204680204681204682204683204684204685204686204687204688204689204690204691204692204693204694204695204696204697204698204699204700204701204702204703204704204705204706204707204708204709204710204711204712204713204714204715204716204717204718204719204720204721204722204723204724204725204726204727204728204729204730204731204732204733204734204735204736204737204738204739204740204741204742204743204744204745204746204747204748204749204750204751204752204753204754204755204756204757204758204759204760204761204762204763204764204765204766204767204768204769204770204771204772204773204774204775204776204777204778204779204780204781204782204783204784204785204786204787204788204789204790204791204792204793204794204795204796204797204798204799204800204801204802204803204804204805204806204807204808204809204810204811204812204813204814204815204816204817204818204819204820204821204822204823204824204825204826204827204828204829204830204831204832204833204834204835204836204837204838204839204840204841204842204843204844204845204846204847204848204849204850204851204852204853204854204855204856204857204858204859204860204861204862204863204864204865204866204867204868204869204870204871204872204873204874204875204876204877204878204879204880204881204882204883204884204885204886204887204888204889204890204891204892204893204894204895204896204897204898204899204900204901204902204903204904204905204906204907204908204909204910204911204912204913204914204915204916204917204918204919204920204921204922204923204924204925204926204927204928204929204930204931204932204933204934204935204936204937204938204939204940204941204942204943204944204945204946204947204948204949204950204951204952204953204954204955204956204957204958204959204960204961204962204963204964204965204966204967204968204969204970204971204972204973204974204975204976204977204978204979204980204981204982204983204984204985204986204987204988204989204990204991204992204993204994204995204996204997204998204999205000205001205002205003205004205005205006205007205008205009205010205011205012205013205014205015205016205017205018205019205020205021205022205023205024205025205026205027205028205029205030205031205032205033205034205035205036205037205038205039205040205041205042205043205044205045205046205047205048205049205050205051205052205053205054205055205056205057205058205059205060205061205062205063205064205065205066205067205068205069205070205071205072205073205074205075205076205077205078205079205080205081205082205083205084205085205086205087205088205089205090205091205092205093205094205095205096205097205098205099205100205101205102205103205104205105205106205107205108205109205110205111205112205113205114205115205116205117205118205119205120205121205122205123205124205125205126205127205128205129205130205131205132205133205134205135205136205137205138205139205140205141205142205143205144205145205146205147205148205149205150205151205152205153205154205155205156205157205158205159205160205161205162205163205164205165205166205167205168205169205170205171205172205173205174205175205176205177205178205179205180205181205182205183205184205185205186205187205188205189205190205191205192205193205194205195205196205197205198205199205200205201205202205203205204205205205206205207205208205209205210205211205212205213205214205215205216205217205218205219205220205221205222205223205224205225205226205227205228205229205230205231205232205233205234205235205236205237205238205239205240205241205242205243205244205245205246205247205248205249205250205251205252205253205254205255205256205257205258205259205260205261205262205263205264205265205266205267205268205269205270205271205272205273205274205275205276205277205278205279205280205281205282205283205284205285205286205287205288205289205290205291205292205293205294205295205296205297205298205299205300205301205302205303205304205305205306205307205308205309205310205311205312205313205314205315205316205317205318205319205320205321205322205323205324205325205326205327205328205329205330205331205332205333205334205335205336205337205338205339205340205341205342205343205344205345205346205347205348205349205350205351205352205353205354205355205356205357205358205359205360205361205362205363205364205365205366205367205368205369205370205371205372205373205374205375205376205377205378205379205380205381205382205383205384205385205386205387205388205389205390205391205392205393205394205395205396205397205398205399205400205401205402205403205404205405205406205407205408205409205410205411205412205413205414205415205416205417205418205419205420205421205422205423205424205425205426205427205428205429205430205431205432205433205434205435205436205437205438205439205440205441205442205443205444205445205446205447205448205449205450205451205452205453205454205455205456205457205458205459205460205461205462205463205464205465205466205467205468205469205470205471205472205473205474205475205476205477205478205479205480205481205482205483205484205485205486205487205488205489205490205491205492205493205494205495205496205497205498205499205500205501205502205503205504205505205506205507205508205509205510205511205512205513205514205515205516205517205518205519205520205521205522205523205524205525205526205527205528205529205530205531205532205533205534205535205536205537205538205539205540205541205542205543205544205545205546205547205548205549205550205551205552205553205554205555205556205557205558205559205560205561205562205563205564205565205566205567205568205569205570205571205572205573205574205575205576205577205578205579205580205581205582205583205584205585205586205587205588205589205590205591205592205593205594205595205596205597205598
  1. {
  2. "creator": "Yosys 0.43 (git sha1 ead4718e5, g++ 14.2.1 -march=x86-64 -mtune=generic -O2 -fno-plt -fexceptions -fstack-clash-protection -fcf-protection -fno-omit-frame-pointer -mno-omit-leaf-frame-pointer -ffile-prefix-map=/build/yosys/src=/usr/src/debug/yosys -fPIC -Os)",
  3. "modules": {
  4. "$__ABC9_DELAY": {
  5. "attributes": {
  6. "blackbox": "00000000000000000000000000000001",
  7. "cells_not_processed": "00000000000000000000000000000001",
  8. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  9. },
  10. "parameter_default_values": {
  11. "DELAY": "00000000000000000000000000000000"
  12. },
  13. "ports": {
  14. "I": {
  15. "direction": "input",
  16. "bits": [ 2 ]
  17. },
  18. "O": {
  19. "direction": "output",
  20. "bits": [ 3 ]
  21. }
  22. },
  23. "cells": {
  24. "$specify$44122": {
  25. "hide_name": 1,
  26. "type": "$specify2",
  27. "parameters": {
  28. "DST_WIDTH": "00000000000000000000000000000001",
  29. "FULL": "0",
  30. "SRC_DST_PEN": "0",
  31. "SRC_DST_POL": "0",
  32. "SRC_WIDTH": "00000000000000000000000000000001",
  33. "T_FALL_MAX": "00000000000000000000000000000000",
  34. "T_FALL_MIN": "00000000000000000000000000000000",
  35. "T_FALL_TYP": "00000000000000000000000000000000",
  36. "T_RISE_MAX": "00000000000000000000000000000000",
  37. "T_RISE_MIN": "00000000000000000000000000000000",
  38. "T_RISE_TYP": "00000000000000000000000000000000"
  39. },
  40. "attributes": {
  41. "module_not_derived": "00000000000000000000000000000001",
  42. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  43. },
  44. "port_directions": {
  45. "DST": "input",
  46. "EN": "input",
  47. "SRC": "input"
  48. },
  49. "connections": {
  50. "DST": [ 3 ],
  51. "EN": [ "1" ],
  52. "SRC": [ 2 ]
  53. }
  54. }
  55. },
  56. "netnames": {
  57. "I": {
  58. "hide_name": 0,
  59. "bits": [ 2 ],
  60. "attributes": {
  61. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  62. }
  63. },
  64. "O": {
  65. "hide_name": 0,
  66. "bits": [ 3 ],
  67. "attributes": {
  68. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  69. }
  70. }
  71. }
  72. },
  73. "$__ABC9_SCC_BREAKER": {
  74. "attributes": {
  75. "dynports": "00000000000000000000000000000001",
  76. "blackbox": "00000000000000000000000000000001",
  77. "cells_not_processed": "00000000000000000000000000000001",
  78. "src": "/usr/bin/../share/yosys/abc9_model.v:9.1-11.10"
  79. },
  80. "parameter_default_values": {
  81. "WIDTH": "00000000000000000000000000000000"
  82. },
  83. "ports": {
  84. "I": {
  85. "direction": "input",
  86. "offset": -1,
  87. "upto": 1,
  88. "bits": [ 2, 3 ]
  89. },
  90. "O": {
  91. "direction": "output",
  92. "offset": -1,
  93. "upto": 1,
  94. "bits": [ 4, 5 ]
  95. }
  96. },
  97. "cells": {
  98. },
  99. "netnames": {
  100. "I": {
  101. "hide_name": 0,
  102. "bits": [ 2, 3 ],
  103. "offset": -1,
  104. "upto": 1,
  105. "attributes": {
  106. "src": "/usr/bin/../share/yosys/abc9_model.v:9.47-9.48"
  107. }
  108. },
  109. "O": {
  110. "hide_name": 0,
  111. "bits": [ 4, 5 ],
  112. "offset": -1,
  113. "upto": 1,
  114. "attributes": {
  115. "src": "/usr/bin/../share/yosys/abc9_model.v:9.69-9.70"
  116. }
  117. }
  118. }
  119. },
  120. "$__DFF_N__$abc9_flop": {
  121. "attributes": {
  122. "abc9_flop": "00000000000000000000000000000001",
  123. "blackbox": "00000000000000000000000000000001",
  124. "cells_not_processed": "00000000000000000000000000000001",
  125. "src": "/usr/bin/../share/yosys/abc9_model.v:14.1-20.10"
  126. },
  127. "ports": {
  128. "C": {
  129. "direction": "input",
  130. "bits": [ 2 ]
  131. },
  132. "D": {
  133. "direction": "input",
  134. "bits": [ 3 ]
  135. },
  136. "Q": {
  137. "direction": "input",
  138. "bits": [ 4 ]
  139. },
  140. "n1": {
  141. "direction": "output",
  142. "bits": [ 5 ]
  143. }
  144. },
  145. "cells": {
  146. },
  147. "netnames": {
  148. "C": {
  149. "hide_name": 0,
  150. "bits": [ 2 ],
  151. "attributes": {
  152. "src": "/usr/bin/../share/yosys/abc9_model.v:14.36-14.37"
  153. }
  154. },
  155. "D": {
  156. "hide_name": 0,
  157. "bits": [ 3 ],
  158. "attributes": {
  159. "src": "/usr/bin/../share/yosys/abc9_model.v:14.39-14.40"
  160. }
  161. },
  162. "Q": {
  163. "hide_name": 0,
  164. "bits": [ 4 ],
  165. "attributes": {
  166. "src": "/usr/bin/../share/yosys/abc9_model.v:14.42-14.43"
  167. }
  168. },
  169. "n1": {
  170. "hide_name": 0,
  171. "bits": [ 5 ],
  172. "attributes": {
  173. "src": "/usr/bin/../share/yosys/abc9_model.v:14.52-14.54"
  174. }
  175. }
  176. }
  177. },
  178. "$__DFF_P__$abc9_flop": {
  179. "attributes": {
  180. "abc9_flop": "00000000000000000000000000000001",
  181. "blackbox": "00000000000000000000000000000001",
  182. "cells_not_processed": "00000000000000000000000000000001",
  183. "src": "/usr/bin/../share/yosys/abc9_model.v:23.1-29.10"
  184. },
  185. "ports": {
  186. "C": {
  187. "direction": "input",
  188. "bits": [ 2 ]
  189. },
  190. "D": {
  191. "direction": "input",
  192. "bits": [ 3 ]
  193. },
  194. "Q": {
  195. "direction": "input",
  196. "bits": [ 4 ]
  197. },
  198. "n1": {
  199. "direction": "output",
  200. "bits": [ 5 ]
  201. }
  202. },
  203. "cells": {
  204. },
  205. "netnames": {
  206. "C": {
  207. "hide_name": 0,
  208. "bits": [ 2 ],
  209. "attributes": {
  210. "src": "/usr/bin/../share/yosys/abc9_model.v:23.36-23.37"
  211. }
  212. },
  213. "D": {
  214. "hide_name": 0,
  215. "bits": [ 3 ],
  216. "attributes": {
  217. "src": "/usr/bin/../share/yosys/abc9_model.v:23.39-23.40"
  218. }
  219. },
  220. "Q": {
  221. "hide_name": 0,
  222. "bits": [ 4 ],
  223. "attributes": {
  224. "src": "/usr/bin/../share/yosys/abc9_model.v:23.42-23.43"
  225. }
  226. },
  227. "n1": {
  228. "hide_name": 0,
  229. "bits": [ 5 ],
  230. "attributes": {
  231. "src": "/usr/bin/../share/yosys/abc9_model.v:23.52-23.54"
  232. }
  233. }
  234. }
  235. },
  236. "$__ICE40_CARRY_WRAPPER": {
  237. "attributes": {
  238. "blackbox": "00000000000000000000000000000001",
  239. "cells_not_processed": "00000000000000000000000000000001",
  240. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:2.1-86.10"
  241. },
  242. "parameter_default_values": {
  243. "I3_IS_CI": "00000000000000000000000000000000",
  244. "LUT": "00000000000000000000000000000000"
  245. },
  246. "ports": {
  247. "CO": {
  248. "direction": "output",
  249. "bits": [ 2 ]
  250. },
  251. "O": {
  252. "direction": "output",
  253. "bits": [ 3 ]
  254. },
  255. "A": {
  256. "direction": "input",
  257. "bits": [ 4 ]
  258. },
  259. "B": {
  260. "direction": "input",
  261. "bits": [ 5 ]
  262. },
  263. "CI": {
  264. "direction": "input",
  265. "bits": [ 6 ]
  266. },
  267. "I0": {
  268. "direction": "input",
  269. "bits": [ 7 ]
  270. },
  271. "I3": {
  272. "direction": "input",
  273. "bits": [ 8 ]
  274. }
  275. },
  276. "cells": {
  277. },
  278. "netnames": {
  279. "A": {
  280. "hide_name": 0,
  281. "bits": [ 4 ],
  282. "attributes": {
  283. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:6.8-6.9"
  284. }
  285. },
  286. "B": {
  287. "hide_name": 0,
  288. "bits": [ 5 ],
  289. "attributes": {
  290. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:6.11-6.12"
  291. }
  292. },
  293. "CI": {
  294. "hide_name": 0,
  295. "bits": [ 6 ],
  296. "attributes": {
  297. "abc9_carry": "00000000000000000000000000000001",
  298. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  299. }
  300. },
  301. "CO": {
  302. "hide_name": 0,
  303. "bits": [ 2 ],
  304. "attributes": {
  305. "abc9_carry": "00000000000000000000000000000001",
  306. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  307. }
  308. },
  309. "I0": {
  310. "hide_name": 0,
  311. "bits": [ 7 ],
  312. "attributes": {
  313. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:9.8-9.10"
  314. }
  315. },
  316. "I3": {
  317. "hide_name": 0,
  318. "bits": [ 8 ],
  319. "attributes": {
  320. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:9.12-9.14"
  321. }
  322. },
  323. "O": {
  324. "hide_name": 0,
  325. "bits": [ 3 ],
  326. "attributes": {
  327. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:5.9-5.10"
  328. }
  329. }
  330. }
  331. },
  332. "$paramod$0995edba3b5d39c0753e657c6041e4ce50627dc5\\SB_RAM40_4KNW": {
  333. "attributes": {
  334. "hdlname": "SB_RAM40_4KNW",
  335. "blackbox": "00000000000000000000000000000001",
  336. "cells_not_processed": "00000000000000000000000000000001",
  337. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1862.1-1996.10"
  338. },
  339. "parameter_default_values": {
  340. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  341. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  342. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  343. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  344. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  345. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  346. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  347. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  348. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  349. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  350. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  351. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  352. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  353. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  354. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  355. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  356. "INIT_FILE": " ",
  357. "READ_MODE": "00000000000000000000000000000001",
  358. "WRITE_MODE": "00000000000000000000000000000000"
  359. },
  360. "ports": {
  361. "RDATA": {
  362. "direction": "output",
  363. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  364. },
  365. "RCLK": {
  366. "direction": "input",
  367. "bits": [ 18 ]
  368. },
  369. "RCLKE": {
  370. "direction": "input",
  371. "bits": [ 19 ]
  372. },
  373. "RE": {
  374. "direction": "input",
  375. "bits": [ 20 ]
  376. },
  377. "RADDR": {
  378. "direction": "input",
  379. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  380. },
  381. "WCLKN": {
  382. "direction": "input",
  383. "bits": [ 32 ]
  384. },
  385. "WCLKE": {
  386. "direction": "input",
  387. "bits": [ 33 ]
  388. },
  389. "WE": {
  390. "direction": "input",
  391. "bits": [ 34 ]
  392. },
  393. "WADDR": {
  394. "direction": "input",
  395. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  396. },
  397. "MASK": {
  398. "direction": "input",
  399. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  400. },
  401. "WDATA": {
  402. "direction": "input",
  403. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  404. }
  405. },
  406. "cells": {
  407. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1977$43662": {
  408. "hide_name": 1,
  409. "type": "$logic_and",
  410. "parameters": {
  411. "A_SIGNED": "00000000000000000000000000000000",
  412. "A_WIDTH": "00000000000000000000000000000001",
  413. "B_SIGNED": "00000000000000000000000000000000",
  414. "B_WIDTH": "00000000000000000000000000000001",
  415. "Y_WIDTH": "00000000000000000000000000000001"
  416. },
  417. "attributes": {
  418. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1977.34-1977.45"
  419. },
  420. "port_directions": {
  421. "A": "input",
  422. "B": "input",
  423. "Y": "output"
  424. },
  425. "connections": {
  426. "A": [ 34 ],
  427. "B": [ 33 ],
  428. "Y": [ 78 ]
  429. }
  430. },
  431. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1979$43663": {
  432. "hide_name": 1,
  433. "type": "$logic_and",
  434. "parameters": {
  435. "A_SIGNED": "00000000000000000000000000000000",
  436. "A_WIDTH": "00000000000000000000000000000001",
  437. "B_SIGNED": "00000000000000000000000000000000",
  438. "B_WIDTH": "00000000000000000000000000000001",
  439. "Y_WIDTH": "00000000000000000000000000000001"
  440. },
  441. "attributes": {
  442. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1979.34-1979.45"
  443. },
  444. "port_directions": {
  445. "A": "input",
  446. "B": "input",
  447. "Y": "output"
  448. },
  449. "connections": {
  450. "A": [ 20 ],
  451. "B": [ 19 ],
  452. "Y": [ 79 ]
  453. }
  454. },
  455. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1985$43664": {
  456. "hide_name": 1,
  457. "type": "$logic_and",
  458. "parameters": {
  459. "A_SIGNED": "00000000000000000000000000000000",
  460. "A_WIDTH": "00000000000000000000000000000001",
  461. "B_SIGNED": "00000000000000000000000000000000",
  462. "B_WIDTH": "00000000000000000000000000000001",
  463. "Y_WIDTH": "00000000000000000000000000000001"
  464. },
  465. "attributes": {
  466. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1985.35-1985.46"
  467. },
  468. "port_directions": {
  469. "A": "input",
  470. "B": "input",
  471. "Y": "output"
  472. },
  473. "connections": {
  474. "A": [ 34 ],
  475. "B": [ 33 ],
  476. "Y": [ 80 ]
  477. }
  478. },
  479. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1989$43665": {
  480. "hide_name": 1,
  481. "type": "$logic_and",
  482. "parameters": {
  483. "A_SIGNED": "00000000000000000000000000000000",
  484. "A_WIDTH": "00000000000000000000000000000001",
  485. "B_SIGNED": "00000000000000000000000000000000",
  486. "B_WIDTH": "00000000000000000000000000000001",
  487. "Y_WIDTH": "00000000000000000000000000000001"
  488. },
  489. "attributes": {
  490. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1989.35-1989.46"
  491. },
  492. "port_directions": {
  493. "A": "input",
  494. "B": "input",
  495. "Y": "output"
  496. },
  497. "connections": {
  498. "A": [ 34 ],
  499. "B": [ 33 ],
  500. "Y": [ 81 ]
  501. }
  502. },
  503. "$specify$2659": {
  504. "hide_name": 1,
  505. "type": "$specrule",
  506. "parameters": {
  507. "DST_PEN": "1",
  508. "DST_POL": "1",
  509. "DST_WIDTH": "00000000000000000000000000000001",
  510. "SRC_PEN": "0",
  511. "SRC_POL": "0",
  512. "SRC_WIDTH": "00000000000000000000000000010000",
  513. "TYPE": "$setup",
  514. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  515. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  516. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  517. "T_LIMIT_MAX": "00000000000000000000001000000101",
  518. "T_LIMIT_MIN": "00000000000000000000001000000101",
  519. "T_LIMIT_TYP": "00000000000000000000001000000101"
  520. },
  521. "attributes": {
  522. "module_not_derived": "00000000000000000000000000000001",
  523. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1977.3-1977.52"
  524. },
  525. "port_directions": {
  526. "DST": "input",
  527. "DST_EN": "output",
  528. "SRC": "input",
  529. "SRC_EN": "output"
  530. },
  531. "connections": {
  532. "DST": [ 32 ],
  533. "DST_EN": [ 78 ],
  534. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  535. "SRC_EN": [ "1" ]
  536. }
  537. },
  538. "$specify$2660": {
  539. "hide_name": 1,
  540. "type": "$specrule",
  541. "parameters": {
  542. "DST_PEN": "1",
  543. "DST_POL": "1",
  544. "DST_WIDTH": "00000000000000000000000000000001",
  545. "SRC_PEN": "0",
  546. "SRC_POL": "0",
  547. "SRC_WIDTH": "00000000000000000000000000001011",
  548. "TYPE": "$setup",
  549. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  550. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  551. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  552. "T_LIMIT_MAX": "00000000000000000000000110000000",
  553. "T_LIMIT_MIN": "00000000000000000000000110000000",
  554. "T_LIMIT_TYP": "00000000000000000000000110000000"
  555. },
  556. "attributes": {
  557. "module_not_derived": "00000000000000000000000000000001",
  558. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1979.3-1979.52"
  559. },
  560. "port_directions": {
  561. "DST": "input",
  562. "DST_EN": "output",
  563. "SRC": "input",
  564. "SRC_EN": "output"
  565. },
  566. "connections": {
  567. "DST": [ 18 ],
  568. "DST_EN": [ 79 ],
  569. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  570. "SRC_EN": [ "1" ]
  571. }
  572. },
  573. "$specify$2661": {
  574. "hide_name": 1,
  575. "type": "$specrule",
  576. "parameters": {
  577. "DST_PEN": "1",
  578. "DST_POL": "1",
  579. "DST_WIDTH": "00000000000000000000000000000001",
  580. "SRC_PEN": "0",
  581. "SRC_POL": "0",
  582. "SRC_WIDTH": "00000000000000000000000000000001",
  583. "TYPE": "$setup",
  584. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  585. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  586. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  587. "T_LIMIT_MAX": "00000000000000000000000111110111",
  588. "T_LIMIT_MIN": "00000000000000000000000111110111",
  589. "T_LIMIT_TYP": "00000000000000000000000111110111"
  590. },
  591. "attributes": {
  592. "module_not_derived": "00000000000000000000000000000001",
  593. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1981.3-1981.36"
  594. },
  595. "port_directions": {
  596. "DST": "input",
  597. "DST_EN": "output",
  598. "SRC": "input",
  599. "SRC_EN": "output"
  600. },
  601. "connections": {
  602. "DST": [ 18 ],
  603. "DST_EN": [ "1" ],
  604. "SRC": [ 19 ],
  605. "SRC_EN": [ "1" ]
  606. }
  607. },
  608. "$specify$2662": {
  609. "hide_name": 1,
  610. "type": "$specrule",
  611. "parameters": {
  612. "DST_PEN": "1",
  613. "DST_POL": "1",
  614. "DST_WIDTH": "00000000000000000000000000000001",
  615. "SRC_PEN": "0",
  616. "SRC_POL": "0",
  617. "SRC_WIDTH": "00000000000000000000000000000001",
  618. "TYPE": "$setup",
  619. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  620. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  621. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  622. "T_LIMIT_MAX": "00000000000000000000000010111001",
  623. "T_LIMIT_MIN": "00000000000000000000000010111001",
  624. "T_LIMIT_TYP": "00000000000000000000000010111001"
  625. },
  626. "attributes": {
  627. "module_not_derived": "00000000000000000000000000000001",
  628. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1983.3-1983.33"
  629. },
  630. "port_directions": {
  631. "DST": "input",
  632. "DST_EN": "output",
  633. "SRC": "input",
  634. "SRC_EN": "output"
  635. },
  636. "connections": {
  637. "DST": [ 18 ],
  638. "DST_EN": [ "1" ],
  639. "SRC": [ 20 ],
  640. "SRC_EN": [ "1" ]
  641. }
  642. },
  643. "$specify$2663": {
  644. "hide_name": 1,
  645. "type": "$specrule",
  646. "parameters": {
  647. "DST_PEN": "1",
  648. "DST_POL": "1",
  649. "DST_WIDTH": "00000000000000000000000000000001",
  650. "SRC_PEN": "0",
  651. "SRC_POL": "0",
  652. "SRC_WIDTH": "00000000000000000000000000001011",
  653. "TYPE": "$setup",
  654. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  655. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  656. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  657. "T_LIMIT_MAX": "00000000000000000000000110101000",
  658. "T_LIMIT_MIN": "00000000000000000000000110101000",
  659. "T_LIMIT_TYP": "00000000000000000000000110101000"
  660. },
  661. "attributes": {
  662. "module_not_derived": "00000000000000000000000000000001",
  663. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1985.3-1985.53"
  664. },
  665. "port_directions": {
  666. "DST": "input",
  667. "DST_EN": "output",
  668. "SRC": "input",
  669. "SRC_EN": "output"
  670. },
  671. "connections": {
  672. "DST": [ 32 ],
  673. "DST_EN": [ 80 ],
  674. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  675. "SRC_EN": [ "1" ]
  676. }
  677. },
  678. "$specify$2664": {
  679. "hide_name": 1,
  680. "type": "$specrule",
  681. "parameters": {
  682. "DST_PEN": "1",
  683. "DST_POL": "1",
  684. "DST_WIDTH": "00000000000000000000000000000001",
  685. "SRC_PEN": "0",
  686. "SRC_POL": "0",
  687. "SRC_WIDTH": "00000000000000000000000000000001",
  688. "TYPE": "$setup",
  689. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  690. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  691. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  692. "T_LIMIT_MAX": "00000000000000000000000111110111",
  693. "T_LIMIT_MIN": "00000000000000000000000111110111",
  694. "T_LIMIT_TYP": "00000000000000000000000111110111"
  695. },
  696. "attributes": {
  697. "module_not_derived": "00000000000000000000000000000001",
  698. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1987.3-1987.37"
  699. },
  700. "port_directions": {
  701. "DST": "input",
  702. "DST_EN": "output",
  703. "SRC": "input",
  704. "SRC_EN": "output"
  705. },
  706. "connections": {
  707. "DST": [ 32 ],
  708. "DST_EN": [ "1" ],
  709. "SRC": [ 33 ],
  710. "SRC_EN": [ "1" ]
  711. }
  712. },
  713. "$specify$2665": {
  714. "hide_name": 1,
  715. "type": "$specrule",
  716. "parameters": {
  717. "DST_PEN": "1",
  718. "DST_POL": "1",
  719. "DST_WIDTH": "00000000000000000000000000000001",
  720. "SRC_PEN": "0",
  721. "SRC_POL": "0",
  722. "SRC_WIDTH": "00000000000000000000000000010000",
  723. "TYPE": "$setup",
  724. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  725. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  726. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  727. "T_LIMIT_MAX": "00000000000000000000000100110001",
  728. "T_LIMIT_MIN": "00000000000000000000000100110001",
  729. "T_LIMIT_TYP": "00000000000000000000000100110001"
  730. },
  731. "attributes": {
  732. "module_not_derived": "00000000000000000000000000000001",
  733. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1989.3-1989.53"
  734. },
  735. "port_directions": {
  736. "DST": "input",
  737. "DST_EN": "output",
  738. "SRC": "input",
  739. "SRC_EN": "output"
  740. },
  741. "connections": {
  742. "DST": [ 32 ],
  743. "DST_EN": [ 81 ],
  744. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  745. "SRC_EN": [ "1" ]
  746. }
  747. },
  748. "$specify$2666": {
  749. "hide_name": 1,
  750. "type": "$specrule",
  751. "parameters": {
  752. "DST_PEN": "1",
  753. "DST_POL": "1",
  754. "DST_WIDTH": "00000000000000000000000000000001",
  755. "SRC_PEN": "0",
  756. "SRC_POL": "0",
  757. "SRC_WIDTH": "00000000000000000000000000000001",
  758. "TYPE": "$setup",
  759. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  760. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  761. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  762. "T_LIMIT_MAX": "00000000000000000000000011111100",
  763. "T_LIMIT_MIN": "00000000000000000000000011111100",
  764. "T_LIMIT_TYP": "00000000000000000000000011111100"
  765. },
  766. "attributes": {
  767. "module_not_derived": "00000000000000000000000000000001",
  768. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1991.3-1991.34"
  769. },
  770. "port_directions": {
  771. "DST": "input",
  772. "DST_EN": "output",
  773. "SRC": "input",
  774. "SRC_EN": "output"
  775. },
  776. "connections": {
  777. "DST": [ 32 ],
  778. "DST_EN": [ "1" ],
  779. "SRC": [ 34 ],
  780. "SRC_EN": [ "1" ]
  781. }
  782. },
  783. "$specify$2667": {
  784. "hide_name": 1,
  785. "type": "$specify3",
  786. "parameters": {
  787. "DAT_DST_PEN": "0",
  788. "DAT_DST_POL": "0",
  789. "DST_WIDTH": "00000000000000000000000000010000",
  790. "EDGE_EN": "1",
  791. "EDGE_POL": "1",
  792. "FULL": "1",
  793. "SRC_DST_PEN": "0",
  794. "SRC_DST_POL": "0",
  795. "SRC_WIDTH": "00000000000000000000000000000001",
  796. "T_FALL_MAX": "00000000000000000000010010011011",
  797. "T_FALL_MIN": "00000000000000000000010010011011",
  798. "T_FALL_TYP": "00000000000000000000010010011011",
  799. "T_RISE_MAX": "00000000000000000000010010011011",
  800. "T_RISE_MIN": "00000000000000000000010010011011",
  801. "T_RISE_TYP": "00000000000000000000010010011011"
  802. },
  803. "attributes": {
  804. "module_not_derived": "00000000000000000000000000000001",
  805. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1993.3-1993.44"
  806. },
  807. "port_directions": {
  808. "DAT": "input",
  809. "DST": "input",
  810. "EN": "input",
  811. "SRC": "input"
  812. },
  813. "connections": {
  814. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  815. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  816. "EN": [ "1" ],
  817. "SRC": [ 18 ]
  818. }
  819. }
  820. },
  821. "netnames": {
  822. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1977$43662_Y": {
  823. "hide_name": 1,
  824. "bits": [ 78 ],
  825. "attributes": {
  826. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1977.34-1977.45"
  827. }
  828. },
  829. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1979$43663_Y": {
  830. "hide_name": 1,
  831. "bits": [ 79 ],
  832. "attributes": {
  833. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1979.34-1979.45"
  834. }
  835. },
  836. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1985$43664_Y": {
  837. "hide_name": 1,
  838. "bits": [ 80 ],
  839. "attributes": {
  840. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1985.35-1985.46"
  841. }
  842. },
  843. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1989$43665_Y": {
  844. "hide_name": 1,
  845. "bits": [ 81 ],
  846. "attributes": {
  847. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1989.35-1989.46"
  848. }
  849. },
  850. "MASK": {
  851. "hide_name": 0,
  852. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  853. "attributes": {
  854. "defaultvalue": "0000000000000000",
  855. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  856. }
  857. },
  858. "RADDR": {
  859. "hide_name": 0,
  860. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  861. "attributes": {
  862. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1867.16-1867.21"
  863. }
  864. },
  865. "RCLK": {
  866. "hide_name": 0,
  867. "bits": [ 18 ],
  868. "attributes": {
  869. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1864.16-1864.20"
  870. }
  871. },
  872. "RCLKE": {
  873. "hide_name": 0,
  874. "bits": [ 19 ],
  875. "attributes": {
  876. "defaultvalue": "1",
  877. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1865.16-1865.21"
  878. }
  879. },
  880. "RDATA": {
  881. "hide_name": 0,
  882. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  883. "attributes": {
  884. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1863.16-1863.21"
  885. }
  886. },
  887. "RE": {
  888. "hide_name": 0,
  889. "bits": [ 20 ],
  890. "attributes": {
  891. "defaultvalue": "0",
  892. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1866.16-1866.18"
  893. }
  894. },
  895. "WADDR": {
  896. "hide_name": 0,
  897. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  898. "attributes": {
  899. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1871.16-1871.21"
  900. }
  901. },
  902. "WCLKE": {
  903. "hide_name": 0,
  904. "bits": [ 33 ],
  905. "attributes": {
  906. "defaultvalue": "1",
  907. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1869.16-1869.21"
  908. }
  909. },
  910. "WCLKN": {
  911. "hide_name": 0,
  912. "bits": [ 32 ],
  913. "attributes": {
  914. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1868.16-1868.21"
  915. }
  916. },
  917. "WDATA": {
  918. "hide_name": 0,
  919. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  920. "attributes": {
  921. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1873.16-1873.21"
  922. }
  923. },
  924. "WE": {
  925. "hide_name": 0,
  926. "bits": [ 34 ],
  927. "attributes": {
  928. "defaultvalue": "0",
  929. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1870.16-1870.18"
  930. }
  931. }
  932. }
  933. },
  934. "$paramod$2949a269df5c3db52940b052c0e157bca6914067\\SB_RAM40_4K": {
  935. "attributes": {
  936. "hdlname": "SB_RAM40_4K",
  937. "blackbox": "00000000000000000000000000000001",
  938. "cells_not_processed": "00000000000000000000000000000001",
  939. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1487.1-1724.10"
  940. },
  941. "parameter_default_values": {
  942. "INIT_0": "0000000010000100000000000100010001000111011001000000000100000000010000000000001010101011101010001110111111101110000000000000001001000101000000000000000000100100101110111011100000010001000101000100000100000000010001000001010100000100010001101000001000000000",
  943. "INIT_1": "0001000101010101000001000000000000010001010101010000000001000000000100010101010100000000010000000101000101010001000100010111010100101000000010000001000101010101000001000000000000010001010101010000000001000000100000000000000000000000000000000000000000000000",
  944. "INIT_2": "1000001000000000000000000000000000010001000100010001000101010101000000000100000001010001010100010001000101110101000010000010101000010001010101010000010000000010000100010101010100000000010000000001000101010101000000000100000000010011011101011000010110000001",
  945. "INIT_3": "0000000000000000010001010000000001000100000000000100010100000000010000000100010010000010000000001010111011101000111011111110111100000000010100010100000101000010000100010001000000010101010101000100000001010011010000110100001100000000000000000100000000000000",
  946. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx0000111011110001000011101100000100001111001111100000111100001110",
  947. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  948. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  949. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  950. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  951. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  952. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  953. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  954. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  955. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  956. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  957. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  958. "INIT_FILE": " ",
  959. "READ_MODE": "00",
  960. "WRITE_MODE": "00"
  961. },
  962. "ports": {
  963. "RDATA": {
  964. "direction": "output",
  965. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  966. },
  967. "RCLK": {
  968. "direction": "input",
  969. "bits": [ 18 ]
  970. },
  971. "RCLKE": {
  972. "direction": "input",
  973. "bits": [ 19 ]
  974. },
  975. "RE": {
  976. "direction": "input",
  977. "bits": [ 20 ]
  978. },
  979. "RADDR": {
  980. "direction": "input",
  981. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  982. },
  983. "WCLK": {
  984. "direction": "input",
  985. "bits": [ 32 ]
  986. },
  987. "WCLKE": {
  988. "direction": "input",
  989. "bits": [ 33 ]
  990. },
  991. "WE": {
  992. "direction": "input",
  993. "bits": [ 34 ]
  994. },
  995. "WADDR": {
  996. "direction": "input",
  997. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  998. },
  999. "MASK": {
  1000. "direction": "input",
  1001. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  1002. },
  1003. "WDATA": {
  1004. "direction": "input",
  1005. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  1006. }
  1007. },
  1008. "cells": {
  1009. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43658": {
  1010. "hide_name": 1,
  1011. "type": "$logic_and",
  1012. "parameters": {
  1013. "A_SIGNED": "00000000000000000000000000000000",
  1014. "A_WIDTH": "00000000000000000000000000000001",
  1015. "B_SIGNED": "00000000000000000000000000000000",
  1016. "B_WIDTH": "00000000000000000000000000000001",
  1017. "Y_WIDTH": "00000000000000000000000000000001"
  1018. },
  1019. "attributes": {
  1020. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  1021. },
  1022. "port_directions": {
  1023. "A": "input",
  1024. "B": "input",
  1025. "Y": "output"
  1026. },
  1027. "connections": {
  1028. "A": [ 34 ],
  1029. "B": [ 33 ],
  1030. "Y": [ 78 ]
  1031. }
  1032. },
  1033. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43659": {
  1034. "hide_name": 1,
  1035. "type": "$logic_and",
  1036. "parameters": {
  1037. "A_SIGNED": "00000000000000000000000000000000",
  1038. "A_WIDTH": "00000000000000000000000000000001",
  1039. "B_SIGNED": "00000000000000000000000000000000",
  1040. "B_WIDTH": "00000000000000000000000000000001",
  1041. "Y_WIDTH": "00000000000000000000000000000001"
  1042. },
  1043. "attributes": {
  1044. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  1045. },
  1046. "port_directions": {
  1047. "A": "input",
  1048. "B": "input",
  1049. "Y": "output"
  1050. },
  1051. "connections": {
  1052. "A": [ 20 ],
  1053. "B": [ 19 ],
  1054. "Y": [ 79 ]
  1055. }
  1056. },
  1057. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43660": {
  1058. "hide_name": 1,
  1059. "type": "$logic_and",
  1060. "parameters": {
  1061. "A_SIGNED": "00000000000000000000000000000000",
  1062. "A_WIDTH": "00000000000000000000000000000001",
  1063. "B_SIGNED": "00000000000000000000000000000000",
  1064. "B_WIDTH": "00000000000000000000000000000001",
  1065. "Y_WIDTH": "00000000000000000000000000000001"
  1066. },
  1067. "attributes": {
  1068. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  1069. },
  1070. "port_directions": {
  1071. "A": "input",
  1072. "B": "input",
  1073. "Y": "output"
  1074. },
  1075. "connections": {
  1076. "A": [ 34 ],
  1077. "B": [ 33 ],
  1078. "Y": [ 80 ]
  1079. }
  1080. },
  1081. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43661": {
  1082. "hide_name": 1,
  1083. "type": "$logic_and",
  1084. "parameters": {
  1085. "A_SIGNED": "00000000000000000000000000000000",
  1086. "A_WIDTH": "00000000000000000000000000000001",
  1087. "B_SIGNED": "00000000000000000000000000000000",
  1088. "B_WIDTH": "00000000000000000000000000000001",
  1089. "Y_WIDTH": "00000000000000000000000000000001"
  1090. },
  1091. "attributes": {
  1092. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  1093. },
  1094. "port_directions": {
  1095. "A": "input",
  1096. "B": "input",
  1097. "Y": "output"
  1098. },
  1099. "connections": {
  1100. "A": [ 34 ],
  1101. "B": [ 33 ],
  1102. "Y": [ 81 ]
  1103. }
  1104. },
  1105. "$specify$2641": {
  1106. "hide_name": 1,
  1107. "type": "$specrule",
  1108. "parameters": {
  1109. "DST_PEN": "1",
  1110. "DST_POL": "1",
  1111. "DST_WIDTH": "00000000000000000000000000000001",
  1112. "SRC_PEN": "0",
  1113. "SRC_POL": "0",
  1114. "SRC_WIDTH": "00000000000000000000000000010000",
  1115. "TYPE": "$setup",
  1116. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1117. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1118. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1119. "T_LIMIT_MAX": "00000000000000000000001000000101",
  1120. "T_LIMIT_MIN": "00000000000000000000001000000101",
  1121. "T_LIMIT_TYP": "00000000000000000000001000000101"
  1122. },
  1123. "attributes": {
  1124. "module_not_derived": "00000000000000000000000000000001",
  1125. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.3-1705.51"
  1126. },
  1127. "port_directions": {
  1128. "DST": "input",
  1129. "DST_EN": "output",
  1130. "SRC": "input",
  1131. "SRC_EN": "output"
  1132. },
  1133. "connections": {
  1134. "DST": [ 32 ],
  1135. "DST_EN": [ 78 ],
  1136. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  1137. "SRC_EN": [ "1" ]
  1138. }
  1139. },
  1140. "$specify$2642": {
  1141. "hide_name": 1,
  1142. "type": "$specrule",
  1143. "parameters": {
  1144. "DST_PEN": "1",
  1145. "DST_POL": "1",
  1146. "DST_WIDTH": "00000000000000000000000000000001",
  1147. "SRC_PEN": "0",
  1148. "SRC_POL": "0",
  1149. "SRC_WIDTH": "00000000000000000000000000001011",
  1150. "TYPE": "$setup",
  1151. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1152. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1153. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1154. "T_LIMIT_MAX": "00000000000000000000000110000000",
  1155. "T_LIMIT_MIN": "00000000000000000000000110000000",
  1156. "T_LIMIT_TYP": "00000000000000000000000110000000"
  1157. },
  1158. "attributes": {
  1159. "module_not_derived": "00000000000000000000000000000001",
  1160. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.3-1707.52"
  1161. },
  1162. "port_directions": {
  1163. "DST": "input",
  1164. "DST_EN": "output",
  1165. "SRC": "input",
  1166. "SRC_EN": "output"
  1167. },
  1168. "connections": {
  1169. "DST": [ 18 ],
  1170. "DST_EN": [ 79 ],
  1171. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  1172. "SRC_EN": [ "1" ]
  1173. }
  1174. },
  1175. "$specify$2643": {
  1176. "hide_name": 1,
  1177. "type": "$specrule",
  1178. "parameters": {
  1179. "DST_PEN": "1",
  1180. "DST_POL": "1",
  1181. "DST_WIDTH": "00000000000000000000000000000001",
  1182. "SRC_PEN": "0",
  1183. "SRC_POL": "0",
  1184. "SRC_WIDTH": "00000000000000000000000000000001",
  1185. "TYPE": "$setup",
  1186. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1187. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1188. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1189. "T_LIMIT_MAX": "00000000000000000000000111110111",
  1190. "T_LIMIT_MIN": "00000000000000000000000111110111",
  1191. "T_LIMIT_TYP": "00000000000000000000000111110111"
  1192. },
  1193. "attributes": {
  1194. "module_not_derived": "00000000000000000000000000000001",
  1195. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1709.3-1709.36"
  1196. },
  1197. "port_directions": {
  1198. "DST": "input",
  1199. "DST_EN": "output",
  1200. "SRC": "input",
  1201. "SRC_EN": "output"
  1202. },
  1203. "connections": {
  1204. "DST": [ 18 ],
  1205. "DST_EN": [ "1" ],
  1206. "SRC": [ 19 ],
  1207. "SRC_EN": [ "1" ]
  1208. }
  1209. },
  1210. "$specify$2644": {
  1211. "hide_name": 1,
  1212. "type": "$specrule",
  1213. "parameters": {
  1214. "DST_PEN": "1",
  1215. "DST_POL": "1",
  1216. "DST_WIDTH": "00000000000000000000000000000001",
  1217. "SRC_PEN": "0",
  1218. "SRC_POL": "0",
  1219. "SRC_WIDTH": "00000000000000000000000000000001",
  1220. "TYPE": "$setup",
  1221. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1222. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1223. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1224. "T_LIMIT_MAX": "00000000000000000000000010111001",
  1225. "T_LIMIT_MIN": "00000000000000000000000010111001",
  1226. "T_LIMIT_TYP": "00000000000000000000000010111001"
  1227. },
  1228. "attributes": {
  1229. "module_not_derived": "00000000000000000000000000000001",
  1230. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1711.3-1711.33"
  1231. },
  1232. "port_directions": {
  1233. "DST": "input",
  1234. "DST_EN": "output",
  1235. "SRC": "input",
  1236. "SRC_EN": "output"
  1237. },
  1238. "connections": {
  1239. "DST": [ 18 ],
  1240. "DST_EN": [ "1" ],
  1241. "SRC": [ 20 ],
  1242. "SRC_EN": [ "1" ]
  1243. }
  1244. },
  1245. "$specify$2645": {
  1246. "hide_name": 1,
  1247. "type": "$specrule",
  1248. "parameters": {
  1249. "DST_PEN": "1",
  1250. "DST_POL": "1",
  1251. "DST_WIDTH": "00000000000000000000000000000001",
  1252. "SRC_PEN": "0",
  1253. "SRC_POL": "0",
  1254. "SRC_WIDTH": "00000000000000000000000000001011",
  1255. "TYPE": "$setup",
  1256. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1257. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1258. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1259. "T_LIMIT_MAX": "00000000000000000000000110101000",
  1260. "T_LIMIT_MIN": "00000000000000000000000110101000",
  1261. "T_LIMIT_TYP": "00000000000000000000000110101000"
  1262. },
  1263. "attributes": {
  1264. "module_not_derived": "00000000000000000000000000000001",
  1265. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.3-1713.52"
  1266. },
  1267. "port_directions": {
  1268. "DST": "input",
  1269. "DST_EN": "output",
  1270. "SRC": "input",
  1271. "SRC_EN": "output"
  1272. },
  1273. "connections": {
  1274. "DST": [ 32 ],
  1275. "DST_EN": [ 80 ],
  1276. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  1277. "SRC_EN": [ "1" ]
  1278. }
  1279. },
  1280. "$specify$2646": {
  1281. "hide_name": 1,
  1282. "type": "$specrule",
  1283. "parameters": {
  1284. "DST_PEN": "1",
  1285. "DST_POL": "1",
  1286. "DST_WIDTH": "00000000000000000000000000000001",
  1287. "SRC_PEN": "0",
  1288. "SRC_POL": "0",
  1289. "SRC_WIDTH": "00000000000000000000000000000001",
  1290. "TYPE": "$setup",
  1291. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1292. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1293. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1294. "T_LIMIT_MAX": "00000000000000000000000111110111",
  1295. "T_LIMIT_MIN": "00000000000000000000000111110111",
  1296. "T_LIMIT_TYP": "00000000000000000000000111110111"
  1297. },
  1298. "attributes": {
  1299. "module_not_derived": "00000000000000000000000000000001",
  1300. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1715.3-1715.36"
  1301. },
  1302. "port_directions": {
  1303. "DST": "input",
  1304. "DST_EN": "output",
  1305. "SRC": "input",
  1306. "SRC_EN": "output"
  1307. },
  1308. "connections": {
  1309. "DST": [ 32 ],
  1310. "DST_EN": [ "1" ],
  1311. "SRC": [ 33 ],
  1312. "SRC_EN": [ "1" ]
  1313. }
  1314. },
  1315. "$specify$2647": {
  1316. "hide_name": 1,
  1317. "type": "$specrule",
  1318. "parameters": {
  1319. "DST_PEN": "1",
  1320. "DST_POL": "1",
  1321. "DST_WIDTH": "00000000000000000000000000000001",
  1322. "SRC_PEN": "0",
  1323. "SRC_POL": "0",
  1324. "SRC_WIDTH": "00000000000000000000000000010000",
  1325. "TYPE": "$setup",
  1326. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1327. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1328. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1329. "T_LIMIT_MAX": "00000000000000000000000100110001",
  1330. "T_LIMIT_MIN": "00000000000000000000000100110001",
  1331. "T_LIMIT_TYP": "00000000000000000000000100110001"
  1332. },
  1333. "attributes": {
  1334. "module_not_derived": "00000000000000000000000000000001",
  1335. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.3-1717.52"
  1336. },
  1337. "port_directions": {
  1338. "DST": "input",
  1339. "DST_EN": "output",
  1340. "SRC": "input",
  1341. "SRC_EN": "output"
  1342. },
  1343. "connections": {
  1344. "DST": [ 32 ],
  1345. "DST_EN": [ 81 ],
  1346. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  1347. "SRC_EN": [ "1" ]
  1348. }
  1349. },
  1350. "$specify$2648": {
  1351. "hide_name": 1,
  1352. "type": "$specrule",
  1353. "parameters": {
  1354. "DST_PEN": "1",
  1355. "DST_POL": "1",
  1356. "DST_WIDTH": "00000000000000000000000000000001",
  1357. "SRC_PEN": "0",
  1358. "SRC_POL": "0",
  1359. "SRC_WIDTH": "00000000000000000000000000000001",
  1360. "TYPE": "$setup",
  1361. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1362. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1363. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1364. "T_LIMIT_MAX": "00000000000000000000000011111100",
  1365. "T_LIMIT_MIN": "00000000000000000000000011111100",
  1366. "T_LIMIT_TYP": "00000000000000000000000011111100"
  1367. },
  1368. "attributes": {
  1369. "module_not_derived": "00000000000000000000000000000001",
  1370. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1719.3-1719.33"
  1371. },
  1372. "port_directions": {
  1373. "DST": "input",
  1374. "DST_EN": "output",
  1375. "SRC": "input",
  1376. "SRC_EN": "output"
  1377. },
  1378. "connections": {
  1379. "DST": [ 32 ],
  1380. "DST_EN": [ "1" ],
  1381. "SRC": [ 34 ],
  1382. "SRC_EN": [ "1" ]
  1383. }
  1384. },
  1385. "$specify$2649": {
  1386. "hide_name": 1,
  1387. "type": "$specify3",
  1388. "parameters": {
  1389. "DAT_DST_PEN": "0",
  1390. "DAT_DST_POL": "0",
  1391. "DST_WIDTH": "00000000000000000000000000010000",
  1392. "EDGE_EN": "1",
  1393. "EDGE_POL": "1",
  1394. "FULL": "1",
  1395. "SRC_DST_PEN": "0",
  1396. "SRC_DST_POL": "0",
  1397. "SRC_WIDTH": "00000000000000000000000000000001",
  1398. "T_FALL_MAX": "00000000000000000000010010011011",
  1399. "T_FALL_MIN": "00000000000000000000010010011011",
  1400. "T_FALL_TYP": "00000000000000000000010010011011",
  1401. "T_RISE_MAX": "00000000000000000000010010011011",
  1402. "T_RISE_MIN": "00000000000000000000010010011011",
  1403. "T_RISE_TYP": "00000000000000000000010010011011"
  1404. },
  1405. "attributes": {
  1406. "module_not_derived": "00000000000000000000000000000001",
  1407. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1721.3-1721.44"
  1408. },
  1409. "port_directions": {
  1410. "DAT": "input",
  1411. "DST": "input",
  1412. "EN": "input",
  1413. "SRC": "input"
  1414. },
  1415. "connections": {
  1416. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  1417. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  1418. "EN": [ "1" ],
  1419. "SRC": [ 18 ]
  1420. }
  1421. }
  1422. },
  1423. "netnames": {
  1424. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43658_Y": {
  1425. "hide_name": 1,
  1426. "bits": [ 78 ],
  1427. "attributes": {
  1428. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  1429. }
  1430. },
  1431. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43659_Y": {
  1432. "hide_name": 1,
  1433. "bits": [ 79 ],
  1434. "attributes": {
  1435. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  1436. }
  1437. },
  1438. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43660_Y": {
  1439. "hide_name": 1,
  1440. "bits": [ 80 ],
  1441. "attributes": {
  1442. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  1443. }
  1444. },
  1445. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43661_Y": {
  1446. "hide_name": 1,
  1447. "bits": [ 81 ],
  1448. "attributes": {
  1449. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  1450. }
  1451. },
  1452. "MASK": {
  1453. "hide_name": 0,
  1454. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  1455. "attributes": {
  1456. "defaultvalue": "0000000000000000",
  1457. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  1458. }
  1459. },
  1460. "RADDR": {
  1461. "hide_name": 0,
  1462. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  1463. "attributes": {
  1464. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1492.16-1492.21"
  1465. }
  1466. },
  1467. "RCLK": {
  1468. "hide_name": 0,
  1469. "bits": [ 18 ],
  1470. "attributes": {
  1471. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1489.16-1489.20"
  1472. }
  1473. },
  1474. "RCLKE": {
  1475. "hide_name": 0,
  1476. "bits": [ 19 ],
  1477. "attributes": {
  1478. "defaultvalue": "1",
  1479. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1490.16-1490.21"
  1480. }
  1481. },
  1482. "RDATA": {
  1483. "hide_name": 0,
  1484. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  1485. "attributes": {
  1486. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21"
  1487. }
  1488. },
  1489. "RE": {
  1490. "hide_name": 0,
  1491. "bits": [ 20 ],
  1492. "attributes": {
  1493. "defaultvalue": "0",
  1494. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1491.16-1491.18"
  1495. }
  1496. },
  1497. "WADDR": {
  1498. "hide_name": 0,
  1499. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  1500. "attributes": {
  1501. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1496.16-1496.21"
  1502. }
  1503. },
  1504. "WCLK": {
  1505. "hide_name": 0,
  1506. "bits": [ 32 ],
  1507. "attributes": {
  1508. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1493.16-1493.20"
  1509. }
  1510. },
  1511. "WCLKE": {
  1512. "hide_name": 0,
  1513. "bits": [ 33 ],
  1514. "attributes": {
  1515. "defaultvalue": "1",
  1516. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  1517. }
  1518. },
  1519. "WDATA": {
  1520. "hide_name": 0,
  1521. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  1522. "attributes": {
  1523. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1498.16-1498.21"
  1524. }
  1525. },
  1526. "WE": {
  1527. "hide_name": 0,
  1528. "bits": [ 34 ],
  1529. "attributes": {
  1530. "defaultvalue": "0",
  1531. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1495.16-1495.18"
  1532. }
  1533. }
  1534. }
  1535. },
  1536. "$paramod$3de16b38bccaf247863fc873bf23c76c0819f04d\\SB_RAM40_4K": {
  1537. "attributes": {
  1538. "hdlname": "SB_RAM40_4K",
  1539. "blackbox": "00000000000000000000000000000001",
  1540. "cells_not_processed": "00000000000000000000000000000001",
  1541. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1487.1-1724.10"
  1542. },
  1543. "parameter_default_values": {
  1544. "INIT_0": "0100010100010101000011010000000111000011000001010100011100010101010101010101000111100111011010011100001100000101010001110001010110001101000000010000000100100111111001010110000111101011101011011110101100100001000011110000000101000001001001110000010100110111",
  1545. "INIT_1": "0000110100000001010000110000010100001101000000010100001100000101000011010000000101000011000001010100101100000001000011010000000101000111000101010000110100000001010000110000010100001101000000010100001100000101001001110011011111100011001001111000010101010001",
  1546. "INIT_2": "0100011100010101100001010101000111000001000001010000110100000001010000110000010101001011000000010000110100000001010001110001010100001101000000010100001100000101000011010000000101000011000001010000110100000001010000110000010100101111000000010100011100010101",
  1547. "INIT_3": "1000010101010001100011010000000100000001001001111000110100000001000000010010011101000111000101010100010101101001000000110000011100000001001011111000110100000001001000110010000100100111001001010010001110101101110000110000011101000011000101110000001100000111",
  1548. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx0000110111100001001111000000111000001100001111100000110000001110",
  1549. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1550. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1551. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1552. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1553. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1554. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1555. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1556. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1557. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1558. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1559. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  1560. "INIT_FILE": " ",
  1561. "READ_MODE": "00",
  1562. "WRITE_MODE": "00"
  1563. },
  1564. "ports": {
  1565. "RDATA": {
  1566. "direction": "output",
  1567. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  1568. },
  1569. "RCLK": {
  1570. "direction": "input",
  1571. "bits": [ 18 ]
  1572. },
  1573. "RCLKE": {
  1574. "direction": "input",
  1575. "bits": [ 19 ]
  1576. },
  1577. "RE": {
  1578. "direction": "input",
  1579. "bits": [ 20 ]
  1580. },
  1581. "RADDR": {
  1582. "direction": "input",
  1583. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  1584. },
  1585. "WCLK": {
  1586. "direction": "input",
  1587. "bits": [ 32 ]
  1588. },
  1589. "WCLKE": {
  1590. "direction": "input",
  1591. "bits": [ 33 ]
  1592. },
  1593. "WE": {
  1594. "direction": "input",
  1595. "bits": [ 34 ]
  1596. },
  1597. "WADDR": {
  1598. "direction": "input",
  1599. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  1600. },
  1601. "MASK": {
  1602. "direction": "input",
  1603. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  1604. },
  1605. "WDATA": {
  1606. "direction": "input",
  1607. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  1608. }
  1609. },
  1610. "cells": {
  1611. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43654": {
  1612. "hide_name": 1,
  1613. "type": "$logic_and",
  1614. "parameters": {
  1615. "A_SIGNED": "00000000000000000000000000000000",
  1616. "A_WIDTH": "00000000000000000000000000000001",
  1617. "B_SIGNED": "00000000000000000000000000000000",
  1618. "B_WIDTH": "00000000000000000000000000000001",
  1619. "Y_WIDTH": "00000000000000000000000000000001"
  1620. },
  1621. "attributes": {
  1622. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  1623. },
  1624. "port_directions": {
  1625. "A": "input",
  1626. "B": "input",
  1627. "Y": "output"
  1628. },
  1629. "connections": {
  1630. "A": [ 34 ],
  1631. "B": [ 33 ],
  1632. "Y": [ 78 ]
  1633. }
  1634. },
  1635. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43655": {
  1636. "hide_name": 1,
  1637. "type": "$logic_and",
  1638. "parameters": {
  1639. "A_SIGNED": "00000000000000000000000000000000",
  1640. "A_WIDTH": "00000000000000000000000000000001",
  1641. "B_SIGNED": "00000000000000000000000000000000",
  1642. "B_WIDTH": "00000000000000000000000000000001",
  1643. "Y_WIDTH": "00000000000000000000000000000001"
  1644. },
  1645. "attributes": {
  1646. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  1647. },
  1648. "port_directions": {
  1649. "A": "input",
  1650. "B": "input",
  1651. "Y": "output"
  1652. },
  1653. "connections": {
  1654. "A": [ 20 ],
  1655. "B": [ 19 ],
  1656. "Y": [ 79 ]
  1657. }
  1658. },
  1659. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43656": {
  1660. "hide_name": 1,
  1661. "type": "$logic_and",
  1662. "parameters": {
  1663. "A_SIGNED": "00000000000000000000000000000000",
  1664. "A_WIDTH": "00000000000000000000000000000001",
  1665. "B_SIGNED": "00000000000000000000000000000000",
  1666. "B_WIDTH": "00000000000000000000000000000001",
  1667. "Y_WIDTH": "00000000000000000000000000000001"
  1668. },
  1669. "attributes": {
  1670. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  1671. },
  1672. "port_directions": {
  1673. "A": "input",
  1674. "B": "input",
  1675. "Y": "output"
  1676. },
  1677. "connections": {
  1678. "A": [ 34 ],
  1679. "B": [ 33 ],
  1680. "Y": [ 80 ]
  1681. }
  1682. },
  1683. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43657": {
  1684. "hide_name": 1,
  1685. "type": "$logic_and",
  1686. "parameters": {
  1687. "A_SIGNED": "00000000000000000000000000000000",
  1688. "A_WIDTH": "00000000000000000000000000000001",
  1689. "B_SIGNED": "00000000000000000000000000000000",
  1690. "B_WIDTH": "00000000000000000000000000000001",
  1691. "Y_WIDTH": "00000000000000000000000000000001"
  1692. },
  1693. "attributes": {
  1694. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  1695. },
  1696. "port_directions": {
  1697. "A": "input",
  1698. "B": "input",
  1699. "Y": "output"
  1700. },
  1701. "connections": {
  1702. "A": [ 34 ],
  1703. "B": [ 33 ],
  1704. "Y": [ 81 ]
  1705. }
  1706. },
  1707. "$specify$2641": {
  1708. "hide_name": 1,
  1709. "type": "$specrule",
  1710. "parameters": {
  1711. "DST_PEN": "1",
  1712. "DST_POL": "1",
  1713. "DST_WIDTH": "00000000000000000000000000000001",
  1714. "SRC_PEN": "0",
  1715. "SRC_POL": "0",
  1716. "SRC_WIDTH": "00000000000000000000000000010000",
  1717. "TYPE": "$setup",
  1718. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1719. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1720. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1721. "T_LIMIT_MAX": "00000000000000000000001000000101",
  1722. "T_LIMIT_MIN": "00000000000000000000001000000101",
  1723. "T_LIMIT_TYP": "00000000000000000000001000000101"
  1724. },
  1725. "attributes": {
  1726. "module_not_derived": "00000000000000000000000000000001",
  1727. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.3-1705.51"
  1728. },
  1729. "port_directions": {
  1730. "DST": "input",
  1731. "DST_EN": "output",
  1732. "SRC": "input",
  1733. "SRC_EN": "output"
  1734. },
  1735. "connections": {
  1736. "DST": [ 32 ],
  1737. "DST_EN": [ 78 ],
  1738. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  1739. "SRC_EN": [ "1" ]
  1740. }
  1741. },
  1742. "$specify$2642": {
  1743. "hide_name": 1,
  1744. "type": "$specrule",
  1745. "parameters": {
  1746. "DST_PEN": "1",
  1747. "DST_POL": "1",
  1748. "DST_WIDTH": "00000000000000000000000000000001",
  1749. "SRC_PEN": "0",
  1750. "SRC_POL": "0",
  1751. "SRC_WIDTH": "00000000000000000000000000001011",
  1752. "TYPE": "$setup",
  1753. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1754. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1755. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1756. "T_LIMIT_MAX": "00000000000000000000000110000000",
  1757. "T_LIMIT_MIN": "00000000000000000000000110000000",
  1758. "T_LIMIT_TYP": "00000000000000000000000110000000"
  1759. },
  1760. "attributes": {
  1761. "module_not_derived": "00000000000000000000000000000001",
  1762. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.3-1707.52"
  1763. },
  1764. "port_directions": {
  1765. "DST": "input",
  1766. "DST_EN": "output",
  1767. "SRC": "input",
  1768. "SRC_EN": "output"
  1769. },
  1770. "connections": {
  1771. "DST": [ 18 ],
  1772. "DST_EN": [ 79 ],
  1773. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  1774. "SRC_EN": [ "1" ]
  1775. }
  1776. },
  1777. "$specify$2643": {
  1778. "hide_name": 1,
  1779. "type": "$specrule",
  1780. "parameters": {
  1781. "DST_PEN": "1",
  1782. "DST_POL": "1",
  1783. "DST_WIDTH": "00000000000000000000000000000001",
  1784. "SRC_PEN": "0",
  1785. "SRC_POL": "0",
  1786. "SRC_WIDTH": "00000000000000000000000000000001",
  1787. "TYPE": "$setup",
  1788. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1789. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1790. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1791. "T_LIMIT_MAX": "00000000000000000000000111110111",
  1792. "T_LIMIT_MIN": "00000000000000000000000111110111",
  1793. "T_LIMIT_TYP": "00000000000000000000000111110111"
  1794. },
  1795. "attributes": {
  1796. "module_not_derived": "00000000000000000000000000000001",
  1797. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1709.3-1709.36"
  1798. },
  1799. "port_directions": {
  1800. "DST": "input",
  1801. "DST_EN": "output",
  1802. "SRC": "input",
  1803. "SRC_EN": "output"
  1804. },
  1805. "connections": {
  1806. "DST": [ 18 ],
  1807. "DST_EN": [ "1" ],
  1808. "SRC": [ 19 ],
  1809. "SRC_EN": [ "1" ]
  1810. }
  1811. },
  1812. "$specify$2644": {
  1813. "hide_name": 1,
  1814. "type": "$specrule",
  1815. "parameters": {
  1816. "DST_PEN": "1",
  1817. "DST_POL": "1",
  1818. "DST_WIDTH": "00000000000000000000000000000001",
  1819. "SRC_PEN": "0",
  1820. "SRC_POL": "0",
  1821. "SRC_WIDTH": "00000000000000000000000000000001",
  1822. "TYPE": "$setup",
  1823. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1824. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1825. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1826. "T_LIMIT_MAX": "00000000000000000000000010111001",
  1827. "T_LIMIT_MIN": "00000000000000000000000010111001",
  1828. "T_LIMIT_TYP": "00000000000000000000000010111001"
  1829. },
  1830. "attributes": {
  1831. "module_not_derived": "00000000000000000000000000000001",
  1832. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1711.3-1711.33"
  1833. },
  1834. "port_directions": {
  1835. "DST": "input",
  1836. "DST_EN": "output",
  1837. "SRC": "input",
  1838. "SRC_EN": "output"
  1839. },
  1840. "connections": {
  1841. "DST": [ 18 ],
  1842. "DST_EN": [ "1" ],
  1843. "SRC": [ 20 ],
  1844. "SRC_EN": [ "1" ]
  1845. }
  1846. },
  1847. "$specify$2645": {
  1848. "hide_name": 1,
  1849. "type": "$specrule",
  1850. "parameters": {
  1851. "DST_PEN": "1",
  1852. "DST_POL": "1",
  1853. "DST_WIDTH": "00000000000000000000000000000001",
  1854. "SRC_PEN": "0",
  1855. "SRC_POL": "0",
  1856. "SRC_WIDTH": "00000000000000000000000000001011",
  1857. "TYPE": "$setup",
  1858. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1859. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1860. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1861. "T_LIMIT_MAX": "00000000000000000000000110101000",
  1862. "T_LIMIT_MIN": "00000000000000000000000110101000",
  1863. "T_LIMIT_TYP": "00000000000000000000000110101000"
  1864. },
  1865. "attributes": {
  1866. "module_not_derived": "00000000000000000000000000000001",
  1867. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.3-1713.52"
  1868. },
  1869. "port_directions": {
  1870. "DST": "input",
  1871. "DST_EN": "output",
  1872. "SRC": "input",
  1873. "SRC_EN": "output"
  1874. },
  1875. "connections": {
  1876. "DST": [ 32 ],
  1877. "DST_EN": [ 80 ],
  1878. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  1879. "SRC_EN": [ "1" ]
  1880. }
  1881. },
  1882. "$specify$2646": {
  1883. "hide_name": 1,
  1884. "type": "$specrule",
  1885. "parameters": {
  1886. "DST_PEN": "1",
  1887. "DST_POL": "1",
  1888. "DST_WIDTH": "00000000000000000000000000000001",
  1889. "SRC_PEN": "0",
  1890. "SRC_POL": "0",
  1891. "SRC_WIDTH": "00000000000000000000000000000001",
  1892. "TYPE": "$setup",
  1893. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1894. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1895. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1896. "T_LIMIT_MAX": "00000000000000000000000111110111",
  1897. "T_LIMIT_MIN": "00000000000000000000000111110111",
  1898. "T_LIMIT_TYP": "00000000000000000000000111110111"
  1899. },
  1900. "attributes": {
  1901. "module_not_derived": "00000000000000000000000000000001",
  1902. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1715.3-1715.36"
  1903. },
  1904. "port_directions": {
  1905. "DST": "input",
  1906. "DST_EN": "output",
  1907. "SRC": "input",
  1908. "SRC_EN": "output"
  1909. },
  1910. "connections": {
  1911. "DST": [ 32 ],
  1912. "DST_EN": [ "1" ],
  1913. "SRC": [ 33 ],
  1914. "SRC_EN": [ "1" ]
  1915. }
  1916. },
  1917. "$specify$2647": {
  1918. "hide_name": 1,
  1919. "type": "$specrule",
  1920. "parameters": {
  1921. "DST_PEN": "1",
  1922. "DST_POL": "1",
  1923. "DST_WIDTH": "00000000000000000000000000000001",
  1924. "SRC_PEN": "0",
  1925. "SRC_POL": "0",
  1926. "SRC_WIDTH": "00000000000000000000000000010000",
  1927. "TYPE": "$setup",
  1928. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1929. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1930. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1931. "T_LIMIT_MAX": "00000000000000000000000100110001",
  1932. "T_LIMIT_MIN": "00000000000000000000000100110001",
  1933. "T_LIMIT_TYP": "00000000000000000000000100110001"
  1934. },
  1935. "attributes": {
  1936. "module_not_derived": "00000000000000000000000000000001",
  1937. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.3-1717.52"
  1938. },
  1939. "port_directions": {
  1940. "DST": "input",
  1941. "DST_EN": "output",
  1942. "SRC": "input",
  1943. "SRC_EN": "output"
  1944. },
  1945. "connections": {
  1946. "DST": [ 32 ],
  1947. "DST_EN": [ 81 ],
  1948. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  1949. "SRC_EN": [ "1" ]
  1950. }
  1951. },
  1952. "$specify$2648": {
  1953. "hide_name": 1,
  1954. "type": "$specrule",
  1955. "parameters": {
  1956. "DST_PEN": "1",
  1957. "DST_POL": "1",
  1958. "DST_WIDTH": "00000000000000000000000000000001",
  1959. "SRC_PEN": "0",
  1960. "SRC_POL": "0",
  1961. "SRC_WIDTH": "00000000000000000000000000000001",
  1962. "TYPE": "$setup",
  1963. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  1964. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  1965. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  1966. "T_LIMIT_MAX": "00000000000000000000000011111100",
  1967. "T_LIMIT_MIN": "00000000000000000000000011111100",
  1968. "T_LIMIT_TYP": "00000000000000000000000011111100"
  1969. },
  1970. "attributes": {
  1971. "module_not_derived": "00000000000000000000000000000001",
  1972. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1719.3-1719.33"
  1973. },
  1974. "port_directions": {
  1975. "DST": "input",
  1976. "DST_EN": "output",
  1977. "SRC": "input",
  1978. "SRC_EN": "output"
  1979. },
  1980. "connections": {
  1981. "DST": [ 32 ],
  1982. "DST_EN": [ "1" ],
  1983. "SRC": [ 34 ],
  1984. "SRC_EN": [ "1" ]
  1985. }
  1986. },
  1987. "$specify$2649": {
  1988. "hide_name": 1,
  1989. "type": "$specify3",
  1990. "parameters": {
  1991. "DAT_DST_PEN": "0",
  1992. "DAT_DST_POL": "0",
  1993. "DST_WIDTH": "00000000000000000000000000010000",
  1994. "EDGE_EN": "1",
  1995. "EDGE_POL": "1",
  1996. "FULL": "1",
  1997. "SRC_DST_PEN": "0",
  1998. "SRC_DST_POL": "0",
  1999. "SRC_WIDTH": "00000000000000000000000000000001",
  2000. "T_FALL_MAX": "00000000000000000000010010011011",
  2001. "T_FALL_MIN": "00000000000000000000010010011011",
  2002. "T_FALL_TYP": "00000000000000000000010010011011",
  2003. "T_RISE_MAX": "00000000000000000000010010011011",
  2004. "T_RISE_MIN": "00000000000000000000010010011011",
  2005. "T_RISE_TYP": "00000000000000000000010010011011"
  2006. },
  2007. "attributes": {
  2008. "module_not_derived": "00000000000000000000000000000001",
  2009. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1721.3-1721.44"
  2010. },
  2011. "port_directions": {
  2012. "DAT": "input",
  2013. "DST": "input",
  2014. "EN": "input",
  2015. "SRC": "input"
  2016. },
  2017. "connections": {
  2018. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  2019. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  2020. "EN": [ "1" ],
  2021. "SRC": [ 18 ]
  2022. }
  2023. }
  2024. },
  2025. "netnames": {
  2026. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43654_Y": {
  2027. "hide_name": 1,
  2028. "bits": [ 78 ],
  2029. "attributes": {
  2030. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  2031. }
  2032. },
  2033. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43655_Y": {
  2034. "hide_name": 1,
  2035. "bits": [ 79 ],
  2036. "attributes": {
  2037. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  2038. }
  2039. },
  2040. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43656_Y": {
  2041. "hide_name": 1,
  2042. "bits": [ 80 ],
  2043. "attributes": {
  2044. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  2045. }
  2046. },
  2047. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43657_Y": {
  2048. "hide_name": 1,
  2049. "bits": [ 81 ],
  2050. "attributes": {
  2051. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  2052. }
  2053. },
  2054. "MASK": {
  2055. "hide_name": 0,
  2056. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  2057. "attributes": {
  2058. "defaultvalue": "0000000000000000",
  2059. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  2060. }
  2061. },
  2062. "RADDR": {
  2063. "hide_name": 0,
  2064. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  2065. "attributes": {
  2066. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1492.16-1492.21"
  2067. }
  2068. },
  2069. "RCLK": {
  2070. "hide_name": 0,
  2071. "bits": [ 18 ],
  2072. "attributes": {
  2073. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1489.16-1489.20"
  2074. }
  2075. },
  2076. "RCLKE": {
  2077. "hide_name": 0,
  2078. "bits": [ 19 ],
  2079. "attributes": {
  2080. "defaultvalue": "1",
  2081. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1490.16-1490.21"
  2082. }
  2083. },
  2084. "RDATA": {
  2085. "hide_name": 0,
  2086. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  2087. "attributes": {
  2088. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21"
  2089. }
  2090. },
  2091. "RE": {
  2092. "hide_name": 0,
  2093. "bits": [ 20 ],
  2094. "attributes": {
  2095. "defaultvalue": "0",
  2096. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1491.16-1491.18"
  2097. }
  2098. },
  2099. "WADDR": {
  2100. "hide_name": 0,
  2101. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  2102. "attributes": {
  2103. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1496.16-1496.21"
  2104. }
  2105. },
  2106. "WCLK": {
  2107. "hide_name": 0,
  2108. "bits": [ 32 ],
  2109. "attributes": {
  2110. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1493.16-1493.20"
  2111. }
  2112. },
  2113. "WCLKE": {
  2114. "hide_name": 0,
  2115. "bits": [ 33 ],
  2116. "attributes": {
  2117. "defaultvalue": "1",
  2118. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  2119. }
  2120. },
  2121. "WDATA": {
  2122. "hide_name": 0,
  2123. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  2124. "attributes": {
  2125. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1498.16-1498.21"
  2126. }
  2127. },
  2128. "WE": {
  2129. "hide_name": 0,
  2130. "bits": [ 34 ],
  2131. "attributes": {
  2132. "defaultvalue": "0",
  2133. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1495.16-1495.18"
  2134. }
  2135. }
  2136. }
  2137. },
  2138. "$paramod$65b9e5893759870fd62e6b87dc6ba151fdc97e95\\SB_RAM40_4K": {
  2139. "attributes": {
  2140. "hdlname": "SB_RAM40_4K",
  2141. "blackbox": "00000000000000000000000000000001",
  2142. "cells_not_processed": "00000000000000000000000000000001",
  2143. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1487.1-1724.10"
  2144. },
  2145. "parameter_default_values": {
  2146. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2147. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2148. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2149. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2150. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2151. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2152. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2153. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2154. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2155. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2156. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2157. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2158. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2159. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2160. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2161. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  2162. "INIT_FILE": " ",
  2163. "READ_MODE": "00",
  2164. "WRITE_MODE": "00"
  2165. },
  2166. "ports": {
  2167. "RDATA": {
  2168. "direction": "output",
  2169. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  2170. },
  2171. "RCLK": {
  2172. "direction": "input",
  2173. "bits": [ 18 ]
  2174. },
  2175. "RCLKE": {
  2176. "direction": "input",
  2177. "bits": [ 19 ]
  2178. },
  2179. "RE": {
  2180. "direction": "input",
  2181. "bits": [ 20 ]
  2182. },
  2183. "RADDR": {
  2184. "direction": "input",
  2185. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  2186. },
  2187. "WCLK": {
  2188. "direction": "input",
  2189. "bits": [ 32 ]
  2190. },
  2191. "WCLKE": {
  2192. "direction": "input",
  2193. "bits": [ 33 ]
  2194. },
  2195. "WE": {
  2196. "direction": "input",
  2197. "bits": [ 34 ]
  2198. },
  2199. "WADDR": {
  2200. "direction": "input",
  2201. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  2202. },
  2203. "MASK": {
  2204. "direction": "input",
  2205. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  2206. },
  2207. "WDATA": {
  2208. "direction": "input",
  2209. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  2210. }
  2211. },
  2212. "cells": {
  2213. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43678": {
  2214. "hide_name": 1,
  2215. "type": "$logic_and",
  2216. "parameters": {
  2217. "A_SIGNED": "00000000000000000000000000000000",
  2218. "A_WIDTH": "00000000000000000000000000000001",
  2219. "B_SIGNED": "00000000000000000000000000000000",
  2220. "B_WIDTH": "00000000000000000000000000000001",
  2221. "Y_WIDTH": "00000000000000000000000000000001"
  2222. },
  2223. "attributes": {
  2224. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  2225. },
  2226. "port_directions": {
  2227. "A": "input",
  2228. "B": "input",
  2229. "Y": "output"
  2230. },
  2231. "connections": {
  2232. "A": [ 34 ],
  2233. "B": [ 33 ],
  2234. "Y": [ 78 ]
  2235. }
  2236. },
  2237. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43679": {
  2238. "hide_name": 1,
  2239. "type": "$logic_and",
  2240. "parameters": {
  2241. "A_SIGNED": "00000000000000000000000000000000",
  2242. "A_WIDTH": "00000000000000000000000000000001",
  2243. "B_SIGNED": "00000000000000000000000000000000",
  2244. "B_WIDTH": "00000000000000000000000000000001",
  2245. "Y_WIDTH": "00000000000000000000000000000001"
  2246. },
  2247. "attributes": {
  2248. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  2249. },
  2250. "port_directions": {
  2251. "A": "input",
  2252. "B": "input",
  2253. "Y": "output"
  2254. },
  2255. "connections": {
  2256. "A": [ 20 ],
  2257. "B": [ 19 ],
  2258. "Y": [ 79 ]
  2259. }
  2260. },
  2261. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43680": {
  2262. "hide_name": 1,
  2263. "type": "$logic_and",
  2264. "parameters": {
  2265. "A_SIGNED": "00000000000000000000000000000000",
  2266. "A_WIDTH": "00000000000000000000000000000001",
  2267. "B_SIGNED": "00000000000000000000000000000000",
  2268. "B_WIDTH": "00000000000000000000000000000001",
  2269. "Y_WIDTH": "00000000000000000000000000000001"
  2270. },
  2271. "attributes": {
  2272. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  2273. },
  2274. "port_directions": {
  2275. "A": "input",
  2276. "B": "input",
  2277. "Y": "output"
  2278. },
  2279. "connections": {
  2280. "A": [ 34 ],
  2281. "B": [ 33 ],
  2282. "Y": [ 80 ]
  2283. }
  2284. },
  2285. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43681": {
  2286. "hide_name": 1,
  2287. "type": "$logic_and",
  2288. "parameters": {
  2289. "A_SIGNED": "00000000000000000000000000000000",
  2290. "A_WIDTH": "00000000000000000000000000000001",
  2291. "B_SIGNED": "00000000000000000000000000000000",
  2292. "B_WIDTH": "00000000000000000000000000000001",
  2293. "Y_WIDTH": "00000000000000000000000000000001"
  2294. },
  2295. "attributes": {
  2296. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  2297. },
  2298. "port_directions": {
  2299. "A": "input",
  2300. "B": "input",
  2301. "Y": "output"
  2302. },
  2303. "connections": {
  2304. "A": [ 34 ],
  2305. "B": [ 33 ],
  2306. "Y": [ 81 ]
  2307. }
  2308. },
  2309. "$specify$2641": {
  2310. "hide_name": 1,
  2311. "type": "$specrule",
  2312. "parameters": {
  2313. "DST_PEN": "1",
  2314. "DST_POL": "1",
  2315. "DST_WIDTH": "00000000000000000000000000000001",
  2316. "SRC_PEN": "0",
  2317. "SRC_POL": "0",
  2318. "SRC_WIDTH": "00000000000000000000000000010000",
  2319. "TYPE": "$setup",
  2320. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2321. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2322. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2323. "T_LIMIT_MAX": "00000000000000000000001000000101",
  2324. "T_LIMIT_MIN": "00000000000000000000001000000101",
  2325. "T_LIMIT_TYP": "00000000000000000000001000000101"
  2326. },
  2327. "attributes": {
  2328. "module_not_derived": "00000000000000000000000000000001",
  2329. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.3-1705.51"
  2330. },
  2331. "port_directions": {
  2332. "DST": "input",
  2333. "DST_EN": "output",
  2334. "SRC": "input",
  2335. "SRC_EN": "output"
  2336. },
  2337. "connections": {
  2338. "DST": [ 32 ],
  2339. "DST_EN": [ 78 ],
  2340. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  2341. "SRC_EN": [ "1" ]
  2342. }
  2343. },
  2344. "$specify$2642": {
  2345. "hide_name": 1,
  2346. "type": "$specrule",
  2347. "parameters": {
  2348. "DST_PEN": "1",
  2349. "DST_POL": "1",
  2350. "DST_WIDTH": "00000000000000000000000000000001",
  2351. "SRC_PEN": "0",
  2352. "SRC_POL": "0",
  2353. "SRC_WIDTH": "00000000000000000000000000001011",
  2354. "TYPE": "$setup",
  2355. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2356. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2357. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2358. "T_LIMIT_MAX": "00000000000000000000000110000000",
  2359. "T_LIMIT_MIN": "00000000000000000000000110000000",
  2360. "T_LIMIT_TYP": "00000000000000000000000110000000"
  2361. },
  2362. "attributes": {
  2363. "module_not_derived": "00000000000000000000000000000001",
  2364. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.3-1707.52"
  2365. },
  2366. "port_directions": {
  2367. "DST": "input",
  2368. "DST_EN": "output",
  2369. "SRC": "input",
  2370. "SRC_EN": "output"
  2371. },
  2372. "connections": {
  2373. "DST": [ 18 ],
  2374. "DST_EN": [ 79 ],
  2375. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  2376. "SRC_EN": [ "1" ]
  2377. }
  2378. },
  2379. "$specify$2643": {
  2380. "hide_name": 1,
  2381. "type": "$specrule",
  2382. "parameters": {
  2383. "DST_PEN": "1",
  2384. "DST_POL": "1",
  2385. "DST_WIDTH": "00000000000000000000000000000001",
  2386. "SRC_PEN": "0",
  2387. "SRC_POL": "0",
  2388. "SRC_WIDTH": "00000000000000000000000000000001",
  2389. "TYPE": "$setup",
  2390. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2391. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2392. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2393. "T_LIMIT_MAX": "00000000000000000000000111110111",
  2394. "T_LIMIT_MIN": "00000000000000000000000111110111",
  2395. "T_LIMIT_TYP": "00000000000000000000000111110111"
  2396. },
  2397. "attributes": {
  2398. "module_not_derived": "00000000000000000000000000000001",
  2399. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1709.3-1709.36"
  2400. },
  2401. "port_directions": {
  2402. "DST": "input",
  2403. "DST_EN": "output",
  2404. "SRC": "input",
  2405. "SRC_EN": "output"
  2406. },
  2407. "connections": {
  2408. "DST": [ 18 ],
  2409. "DST_EN": [ "1" ],
  2410. "SRC": [ 19 ],
  2411. "SRC_EN": [ "1" ]
  2412. }
  2413. },
  2414. "$specify$2644": {
  2415. "hide_name": 1,
  2416. "type": "$specrule",
  2417. "parameters": {
  2418. "DST_PEN": "1",
  2419. "DST_POL": "1",
  2420. "DST_WIDTH": "00000000000000000000000000000001",
  2421. "SRC_PEN": "0",
  2422. "SRC_POL": "0",
  2423. "SRC_WIDTH": "00000000000000000000000000000001",
  2424. "TYPE": "$setup",
  2425. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2426. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2427. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2428. "T_LIMIT_MAX": "00000000000000000000000010111001",
  2429. "T_LIMIT_MIN": "00000000000000000000000010111001",
  2430. "T_LIMIT_TYP": "00000000000000000000000010111001"
  2431. },
  2432. "attributes": {
  2433. "module_not_derived": "00000000000000000000000000000001",
  2434. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1711.3-1711.33"
  2435. },
  2436. "port_directions": {
  2437. "DST": "input",
  2438. "DST_EN": "output",
  2439. "SRC": "input",
  2440. "SRC_EN": "output"
  2441. },
  2442. "connections": {
  2443. "DST": [ 18 ],
  2444. "DST_EN": [ "1" ],
  2445. "SRC": [ 20 ],
  2446. "SRC_EN": [ "1" ]
  2447. }
  2448. },
  2449. "$specify$2645": {
  2450. "hide_name": 1,
  2451. "type": "$specrule",
  2452. "parameters": {
  2453. "DST_PEN": "1",
  2454. "DST_POL": "1",
  2455. "DST_WIDTH": "00000000000000000000000000000001",
  2456. "SRC_PEN": "0",
  2457. "SRC_POL": "0",
  2458. "SRC_WIDTH": "00000000000000000000000000001011",
  2459. "TYPE": "$setup",
  2460. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2461. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2462. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2463. "T_LIMIT_MAX": "00000000000000000000000110101000",
  2464. "T_LIMIT_MIN": "00000000000000000000000110101000",
  2465. "T_LIMIT_TYP": "00000000000000000000000110101000"
  2466. },
  2467. "attributes": {
  2468. "module_not_derived": "00000000000000000000000000000001",
  2469. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.3-1713.52"
  2470. },
  2471. "port_directions": {
  2472. "DST": "input",
  2473. "DST_EN": "output",
  2474. "SRC": "input",
  2475. "SRC_EN": "output"
  2476. },
  2477. "connections": {
  2478. "DST": [ 32 ],
  2479. "DST_EN": [ 80 ],
  2480. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  2481. "SRC_EN": [ "1" ]
  2482. }
  2483. },
  2484. "$specify$2646": {
  2485. "hide_name": 1,
  2486. "type": "$specrule",
  2487. "parameters": {
  2488. "DST_PEN": "1",
  2489. "DST_POL": "1",
  2490. "DST_WIDTH": "00000000000000000000000000000001",
  2491. "SRC_PEN": "0",
  2492. "SRC_POL": "0",
  2493. "SRC_WIDTH": "00000000000000000000000000000001",
  2494. "TYPE": "$setup",
  2495. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2496. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2497. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2498. "T_LIMIT_MAX": "00000000000000000000000111110111",
  2499. "T_LIMIT_MIN": "00000000000000000000000111110111",
  2500. "T_LIMIT_TYP": "00000000000000000000000111110111"
  2501. },
  2502. "attributes": {
  2503. "module_not_derived": "00000000000000000000000000000001",
  2504. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1715.3-1715.36"
  2505. },
  2506. "port_directions": {
  2507. "DST": "input",
  2508. "DST_EN": "output",
  2509. "SRC": "input",
  2510. "SRC_EN": "output"
  2511. },
  2512. "connections": {
  2513. "DST": [ 32 ],
  2514. "DST_EN": [ "1" ],
  2515. "SRC": [ 33 ],
  2516. "SRC_EN": [ "1" ]
  2517. }
  2518. },
  2519. "$specify$2647": {
  2520. "hide_name": 1,
  2521. "type": "$specrule",
  2522. "parameters": {
  2523. "DST_PEN": "1",
  2524. "DST_POL": "1",
  2525. "DST_WIDTH": "00000000000000000000000000000001",
  2526. "SRC_PEN": "0",
  2527. "SRC_POL": "0",
  2528. "SRC_WIDTH": "00000000000000000000000000010000",
  2529. "TYPE": "$setup",
  2530. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2531. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2532. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2533. "T_LIMIT_MAX": "00000000000000000000000100110001",
  2534. "T_LIMIT_MIN": "00000000000000000000000100110001",
  2535. "T_LIMIT_TYP": "00000000000000000000000100110001"
  2536. },
  2537. "attributes": {
  2538. "module_not_derived": "00000000000000000000000000000001",
  2539. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.3-1717.52"
  2540. },
  2541. "port_directions": {
  2542. "DST": "input",
  2543. "DST_EN": "output",
  2544. "SRC": "input",
  2545. "SRC_EN": "output"
  2546. },
  2547. "connections": {
  2548. "DST": [ 32 ],
  2549. "DST_EN": [ 81 ],
  2550. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  2551. "SRC_EN": [ "1" ]
  2552. }
  2553. },
  2554. "$specify$2648": {
  2555. "hide_name": 1,
  2556. "type": "$specrule",
  2557. "parameters": {
  2558. "DST_PEN": "1",
  2559. "DST_POL": "1",
  2560. "DST_WIDTH": "00000000000000000000000000000001",
  2561. "SRC_PEN": "0",
  2562. "SRC_POL": "0",
  2563. "SRC_WIDTH": "00000000000000000000000000000001",
  2564. "TYPE": "$setup",
  2565. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2566. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2567. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2568. "T_LIMIT_MAX": "00000000000000000000000011111100",
  2569. "T_LIMIT_MIN": "00000000000000000000000011111100",
  2570. "T_LIMIT_TYP": "00000000000000000000000011111100"
  2571. },
  2572. "attributes": {
  2573. "module_not_derived": "00000000000000000000000000000001",
  2574. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1719.3-1719.33"
  2575. },
  2576. "port_directions": {
  2577. "DST": "input",
  2578. "DST_EN": "output",
  2579. "SRC": "input",
  2580. "SRC_EN": "output"
  2581. },
  2582. "connections": {
  2583. "DST": [ 32 ],
  2584. "DST_EN": [ "1" ],
  2585. "SRC": [ 34 ],
  2586. "SRC_EN": [ "1" ]
  2587. }
  2588. },
  2589. "$specify$2649": {
  2590. "hide_name": 1,
  2591. "type": "$specify3",
  2592. "parameters": {
  2593. "DAT_DST_PEN": "0",
  2594. "DAT_DST_POL": "0",
  2595. "DST_WIDTH": "00000000000000000000000000010000",
  2596. "EDGE_EN": "1",
  2597. "EDGE_POL": "1",
  2598. "FULL": "1",
  2599. "SRC_DST_PEN": "0",
  2600. "SRC_DST_POL": "0",
  2601. "SRC_WIDTH": "00000000000000000000000000000001",
  2602. "T_FALL_MAX": "00000000000000000000010010011011",
  2603. "T_FALL_MIN": "00000000000000000000010010011011",
  2604. "T_FALL_TYP": "00000000000000000000010010011011",
  2605. "T_RISE_MAX": "00000000000000000000010010011011",
  2606. "T_RISE_MIN": "00000000000000000000010010011011",
  2607. "T_RISE_TYP": "00000000000000000000010010011011"
  2608. },
  2609. "attributes": {
  2610. "module_not_derived": "00000000000000000000000000000001",
  2611. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1721.3-1721.44"
  2612. },
  2613. "port_directions": {
  2614. "DAT": "input",
  2615. "DST": "input",
  2616. "EN": "input",
  2617. "SRC": "input"
  2618. },
  2619. "connections": {
  2620. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  2621. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  2622. "EN": [ "1" ],
  2623. "SRC": [ 18 ]
  2624. }
  2625. }
  2626. },
  2627. "netnames": {
  2628. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43678_Y": {
  2629. "hide_name": 1,
  2630. "bits": [ 78 ],
  2631. "attributes": {
  2632. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  2633. }
  2634. },
  2635. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43679_Y": {
  2636. "hide_name": 1,
  2637. "bits": [ 79 ],
  2638. "attributes": {
  2639. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  2640. }
  2641. },
  2642. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43680_Y": {
  2643. "hide_name": 1,
  2644. "bits": [ 80 ],
  2645. "attributes": {
  2646. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  2647. }
  2648. },
  2649. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43681_Y": {
  2650. "hide_name": 1,
  2651. "bits": [ 81 ],
  2652. "attributes": {
  2653. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  2654. }
  2655. },
  2656. "MASK": {
  2657. "hide_name": 0,
  2658. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  2659. "attributes": {
  2660. "defaultvalue": "0000000000000000",
  2661. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  2662. }
  2663. },
  2664. "RADDR": {
  2665. "hide_name": 0,
  2666. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  2667. "attributes": {
  2668. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1492.16-1492.21"
  2669. }
  2670. },
  2671. "RCLK": {
  2672. "hide_name": 0,
  2673. "bits": [ 18 ],
  2674. "attributes": {
  2675. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1489.16-1489.20"
  2676. }
  2677. },
  2678. "RCLKE": {
  2679. "hide_name": 0,
  2680. "bits": [ 19 ],
  2681. "attributes": {
  2682. "defaultvalue": "1",
  2683. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1490.16-1490.21"
  2684. }
  2685. },
  2686. "RDATA": {
  2687. "hide_name": 0,
  2688. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  2689. "attributes": {
  2690. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21"
  2691. }
  2692. },
  2693. "RE": {
  2694. "hide_name": 0,
  2695. "bits": [ 20 ],
  2696. "attributes": {
  2697. "defaultvalue": "0",
  2698. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1491.16-1491.18"
  2699. }
  2700. },
  2701. "WADDR": {
  2702. "hide_name": 0,
  2703. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  2704. "attributes": {
  2705. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1496.16-1496.21"
  2706. }
  2707. },
  2708. "WCLK": {
  2709. "hide_name": 0,
  2710. "bits": [ 32 ],
  2711. "attributes": {
  2712. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1493.16-1493.20"
  2713. }
  2714. },
  2715. "WCLKE": {
  2716. "hide_name": 0,
  2717. "bits": [ 33 ],
  2718. "attributes": {
  2719. "defaultvalue": "1",
  2720. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  2721. }
  2722. },
  2723. "WDATA": {
  2724. "hide_name": 0,
  2725. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  2726. "attributes": {
  2727. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1498.16-1498.21"
  2728. }
  2729. },
  2730. "WE": {
  2731. "hide_name": 0,
  2732. "bits": [ 34 ],
  2733. "attributes": {
  2734. "defaultvalue": "0",
  2735. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1495.16-1495.18"
  2736. }
  2737. }
  2738. }
  2739. },
  2740. "$paramod$7d38eb718a152176365f3bb0cbbaf0f0d310aac5\\SB_RAM40_4K": {
  2741. "attributes": {
  2742. "hdlname": "SB_RAM40_4K",
  2743. "blackbox": "00000000000000000000000000000001",
  2744. "cells_not_processed": "00000000000000000000000000000001",
  2745. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1487.1-1724.10"
  2746. },
  2747. "parameter_default_values": {
  2748. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2749. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2750. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2751. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2752. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2753. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2754. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2755. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2756. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2757. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2758. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2759. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2760. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2761. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2762. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2763. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  2764. "INIT_FILE": " ",
  2765. "READ_MODE": "00000000000000000000000000000000",
  2766. "WRITE_MODE": "00000000000000000000000000000000"
  2767. },
  2768. "ports": {
  2769. "RDATA": {
  2770. "direction": "output",
  2771. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  2772. },
  2773. "RCLK": {
  2774. "direction": "input",
  2775. "bits": [ 18 ]
  2776. },
  2777. "RCLKE": {
  2778. "direction": "input",
  2779. "bits": [ 19 ]
  2780. },
  2781. "RE": {
  2782. "direction": "input",
  2783. "bits": [ 20 ]
  2784. },
  2785. "RADDR": {
  2786. "direction": "input",
  2787. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  2788. },
  2789. "WCLK": {
  2790. "direction": "input",
  2791. "bits": [ 32 ]
  2792. },
  2793. "WCLKE": {
  2794. "direction": "input",
  2795. "bits": [ 33 ]
  2796. },
  2797. "WE": {
  2798. "direction": "input",
  2799. "bits": [ 34 ]
  2800. },
  2801. "WADDR": {
  2802. "direction": "input",
  2803. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  2804. },
  2805. "MASK": {
  2806. "direction": "input",
  2807. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  2808. },
  2809. "WDATA": {
  2810. "direction": "input",
  2811. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  2812. }
  2813. },
  2814. "cells": {
  2815. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43686": {
  2816. "hide_name": 1,
  2817. "type": "$logic_and",
  2818. "parameters": {
  2819. "A_SIGNED": "00000000000000000000000000000000",
  2820. "A_WIDTH": "00000000000000000000000000000001",
  2821. "B_SIGNED": "00000000000000000000000000000000",
  2822. "B_WIDTH": "00000000000000000000000000000001",
  2823. "Y_WIDTH": "00000000000000000000000000000001"
  2824. },
  2825. "attributes": {
  2826. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  2827. },
  2828. "port_directions": {
  2829. "A": "input",
  2830. "B": "input",
  2831. "Y": "output"
  2832. },
  2833. "connections": {
  2834. "A": [ 34 ],
  2835. "B": [ 33 ],
  2836. "Y": [ 78 ]
  2837. }
  2838. },
  2839. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43687": {
  2840. "hide_name": 1,
  2841. "type": "$logic_and",
  2842. "parameters": {
  2843. "A_SIGNED": "00000000000000000000000000000000",
  2844. "A_WIDTH": "00000000000000000000000000000001",
  2845. "B_SIGNED": "00000000000000000000000000000000",
  2846. "B_WIDTH": "00000000000000000000000000000001",
  2847. "Y_WIDTH": "00000000000000000000000000000001"
  2848. },
  2849. "attributes": {
  2850. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  2851. },
  2852. "port_directions": {
  2853. "A": "input",
  2854. "B": "input",
  2855. "Y": "output"
  2856. },
  2857. "connections": {
  2858. "A": [ 20 ],
  2859. "B": [ 19 ],
  2860. "Y": [ 79 ]
  2861. }
  2862. },
  2863. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43688": {
  2864. "hide_name": 1,
  2865. "type": "$logic_and",
  2866. "parameters": {
  2867. "A_SIGNED": "00000000000000000000000000000000",
  2868. "A_WIDTH": "00000000000000000000000000000001",
  2869. "B_SIGNED": "00000000000000000000000000000000",
  2870. "B_WIDTH": "00000000000000000000000000000001",
  2871. "Y_WIDTH": "00000000000000000000000000000001"
  2872. },
  2873. "attributes": {
  2874. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  2875. },
  2876. "port_directions": {
  2877. "A": "input",
  2878. "B": "input",
  2879. "Y": "output"
  2880. },
  2881. "connections": {
  2882. "A": [ 34 ],
  2883. "B": [ 33 ],
  2884. "Y": [ 80 ]
  2885. }
  2886. },
  2887. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43689": {
  2888. "hide_name": 1,
  2889. "type": "$logic_and",
  2890. "parameters": {
  2891. "A_SIGNED": "00000000000000000000000000000000",
  2892. "A_WIDTH": "00000000000000000000000000000001",
  2893. "B_SIGNED": "00000000000000000000000000000000",
  2894. "B_WIDTH": "00000000000000000000000000000001",
  2895. "Y_WIDTH": "00000000000000000000000000000001"
  2896. },
  2897. "attributes": {
  2898. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  2899. },
  2900. "port_directions": {
  2901. "A": "input",
  2902. "B": "input",
  2903. "Y": "output"
  2904. },
  2905. "connections": {
  2906. "A": [ 34 ],
  2907. "B": [ 33 ],
  2908. "Y": [ 81 ]
  2909. }
  2910. },
  2911. "$specify$2641": {
  2912. "hide_name": 1,
  2913. "type": "$specrule",
  2914. "parameters": {
  2915. "DST_PEN": "1",
  2916. "DST_POL": "1",
  2917. "DST_WIDTH": "00000000000000000000000000000001",
  2918. "SRC_PEN": "0",
  2919. "SRC_POL": "0",
  2920. "SRC_WIDTH": "00000000000000000000000000010000",
  2921. "TYPE": "$setup",
  2922. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2923. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2924. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2925. "T_LIMIT_MAX": "00000000000000000000001000000101",
  2926. "T_LIMIT_MIN": "00000000000000000000001000000101",
  2927. "T_LIMIT_TYP": "00000000000000000000001000000101"
  2928. },
  2929. "attributes": {
  2930. "module_not_derived": "00000000000000000000000000000001",
  2931. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.3-1705.51"
  2932. },
  2933. "port_directions": {
  2934. "DST": "input",
  2935. "DST_EN": "output",
  2936. "SRC": "input",
  2937. "SRC_EN": "output"
  2938. },
  2939. "connections": {
  2940. "DST": [ 32 ],
  2941. "DST_EN": [ 78 ],
  2942. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  2943. "SRC_EN": [ "1" ]
  2944. }
  2945. },
  2946. "$specify$2642": {
  2947. "hide_name": 1,
  2948. "type": "$specrule",
  2949. "parameters": {
  2950. "DST_PEN": "1",
  2951. "DST_POL": "1",
  2952. "DST_WIDTH": "00000000000000000000000000000001",
  2953. "SRC_PEN": "0",
  2954. "SRC_POL": "0",
  2955. "SRC_WIDTH": "00000000000000000000000000001011",
  2956. "TYPE": "$setup",
  2957. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2958. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2959. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2960. "T_LIMIT_MAX": "00000000000000000000000110000000",
  2961. "T_LIMIT_MIN": "00000000000000000000000110000000",
  2962. "T_LIMIT_TYP": "00000000000000000000000110000000"
  2963. },
  2964. "attributes": {
  2965. "module_not_derived": "00000000000000000000000000000001",
  2966. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.3-1707.52"
  2967. },
  2968. "port_directions": {
  2969. "DST": "input",
  2970. "DST_EN": "output",
  2971. "SRC": "input",
  2972. "SRC_EN": "output"
  2973. },
  2974. "connections": {
  2975. "DST": [ 18 ],
  2976. "DST_EN": [ 79 ],
  2977. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  2978. "SRC_EN": [ "1" ]
  2979. }
  2980. },
  2981. "$specify$2643": {
  2982. "hide_name": 1,
  2983. "type": "$specrule",
  2984. "parameters": {
  2985. "DST_PEN": "1",
  2986. "DST_POL": "1",
  2987. "DST_WIDTH": "00000000000000000000000000000001",
  2988. "SRC_PEN": "0",
  2989. "SRC_POL": "0",
  2990. "SRC_WIDTH": "00000000000000000000000000000001",
  2991. "TYPE": "$setup",
  2992. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  2993. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  2994. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  2995. "T_LIMIT_MAX": "00000000000000000000000111110111",
  2996. "T_LIMIT_MIN": "00000000000000000000000111110111",
  2997. "T_LIMIT_TYP": "00000000000000000000000111110111"
  2998. },
  2999. "attributes": {
  3000. "module_not_derived": "00000000000000000000000000000001",
  3001. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1709.3-1709.36"
  3002. },
  3003. "port_directions": {
  3004. "DST": "input",
  3005. "DST_EN": "output",
  3006. "SRC": "input",
  3007. "SRC_EN": "output"
  3008. },
  3009. "connections": {
  3010. "DST": [ 18 ],
  3011. "DST_EN": [ "1" ],
  3012. "SRC": [ 19 ],
  3013. "SRC_EN": [ "1" ]
  3014. }
  3015. },
  3016. "$specify$2644": {
  3017. "hide_name": 1,
  3018. "type": "$specrule",
  3019. "parameters": {
  3020. "DST_PEN": "1",
  3021. "DST_POL": "1",
  3022. "DST_WIDTH": "00000000000000000000000000000001",
  3023. "SRC_PEN": "0",
  3024. "SRC_POL": "0",
  3025. "SRC_WIDTH": "00000000000000000000000000000001",
  3026. "TYPE": "$setup",
  3027. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  3028. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  3029. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  3030. "T_LIMIT_MAX": "00000000000000000000000010111001",
  3031. "T_LIMIT_MIN": "00000000000000000000000010111001",
  3032. "T_LIMIT_TYP": "00000000000000000000000010111001"
  3033. },
  3034. "attributes": {
  3035. "module_not_derived": "00000000000000000000000000000001",
  3036. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1711.3-1711.33"
  3037. },
  3038. "port_directions": {
  3039. "DST": "input",
  3040. "DST_EN": "output",
  3041. "SRC": "input",
  3042. "SRC_EN": "output"
  3043. },
  3044. "connections": {
  3045. "DST": [ 18 ],
  3046. "DST_EN": [ "1" ],
  3047. "SRC": [ 20 ],
  3048. "SRC_EN": [ "1" ]
  3049. }
  3050. },
  3051. "$specify$2645": {
  3052. "hide_name": 1,
  3053. "type": "$specrule",
  3054. "parameters": {
  3055. "DST_PEN": "1",
  3056. "DST_POL": "1",
  3057. "DST_WIDTH": "00000000000000000000000000000001",
  3058. "SRC_PEN": "0",
  3059. "SRC_POL": "0",
  3060. "SRC_WIDTH": "00000000000000000000000000001011",
  3061. "TYPE": "$setup",
  3062. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  3063. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  3064. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  3065. "T_LIMIT_MAX": "00000000000000000000000110101000",
  3066. "T_LIMIT_MIN": "00000000000000000000000110101000",
  3067. "T_LIMIT_TYP": "00000000000000000000000110101000"
  3068. },
  3069. "attributes": {
  3070. "module_not_derived": "00000000000000000000000000000001",
  3071. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.3-1713.52"
  3072. },
  3073. "port_directions": {
  3074. "DST": "input",
  3075. "DST_EN": "output",
  3076. "SRC": "input",
  3077. "SRC_EN": "output"
  3078. },
  3079. "connections": {
  3080. "DST": [ 32 ],
  3081. "DST_EN": [ 80 ],
  3082. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  3083. "SRC_EN": [ "1" ]
  3084. }
  3085. },
  3086. "$specify$2646": {
  3087. "hide_name": 1,
  3088. "type": "$specrule",
  3089. "parameters": {
  3090. "DST_PEN": "1",
  3091. "DST_POL": "1",
  3092. "DST_WIDTH": "00000000000000000000000000000001",
  3093. "SRC_PEN": "0",
  3094. "SRC_POL": "0",
  3095. "SRC_WIDTH": "00000000000000000000000000000001",
  3096. "TYPE": "$setup",
  3097. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  3098. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  3099. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  3100. "T_LIMIT_MAX": "00000000000000000000000111110111",
  3101. "T_LIMIT_MIN": "00000000000000000000000111110111",
  3102. "T_LIMIT_TYP": "00000000000000000000000111110111"
  3103. },
  3104. "attributes": {
  3105. "module_not_derived": "00000000000000000000000000000001",
  3106. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1715.3-1715.36"
  3107. },
  3108. "port_directions": {
  3109. "DST": "input",
  3110. "DST_EN": "output",
  3111. "SRC": "input",
  3112. "SRC_EN": "output"
  3113. },
  3114. "connections": {
  3115. "DST": [ 32 ],
  3116. "DST_EN": [ "1" ],
  3117. "SRC": [ 33 ],
  3118. "SRC_EN": [ "1" ]
  3119. }
  3120. },
  3121. "$specify$2647": {
  3122. "hide_name": 1,
  3123. "type": "$specrule",
  3124. "parameters": {
  3125. "DST_PEN": "1",
  3126. "DST_POL": "1",
  3127. "DST_WIDTH": "00000000000000000000000000000001",
  3128. "SRC_PEN": "0",
  3129. "SRC_POL": "0",
  3130. "SRC_WIDTH": "00000000000000000000000000010000",
  3131. "TYPE": "$setup",
  3132. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  3133. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  3134. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  3135. "T_LIMIT_MAX": "00000000000000000000000100110001",
  3136. "T_LIMIT_MIN": "00000000000000000000000100110001",
  3137. "T_LIMIT_TYP": "00000000000000000000000100110001"
  3138. },
  3139. "attributes": {
  3140. "module_not_derived": "00000000000000000000000000000001",
  3141. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.3-1717.52"
  3142. },
  3143. "port_directions": {
  3144. "DST": "input",
  3145. "DST_EN": "output",
  3146. "SRC": "input",
  3147. "SRC_EN": "output"
  3148. },
  3149. "connections": {
  3150. "DST": [ 32 ],
  3151. "DST_EN": [ 81 ],
  3152. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  3153. "SRC_EN": [ "1" ]
  3154. }
  3155. },
  3156. "$specify$2648": {
  3157. "hide_name": 1,
  3158. "type": "$specrule",
  3159. "parameters": {
  3160. "DST_PEN": "1",
  3161. "DST_POL": "1",
  3162. "DST_WIDTH": "00000000000000000000000000000001",
  3163. "SRC_PEN": "0",
  3164. "SRC_POL": "0",
  3165. "SRC_WIDTH": "00000000000000000000000000000001",
  3166. "TYPE": "$setup",
  3167. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  3168. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  3169. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  3170. "T_LIMIT_MAX": "00000000000000000000000011111100",
  3171. "T_LIMIT_MIN": "00000000000000000000000011111100",
  3172. "T_LIMIT_TYP": "00000000000000000000000011111100"
  3173. },
  3174. "attributes": {
  3175. "module_not_derived": "00000000000000000000000000000001",
  3176. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1719.3-1719.33"
  3177. },
  3178. "port_directions": {
  3179. "DST": "input",
  3180. "DST_EN": "output",
  3181. "SRC": "input",
  3182. "SRC_EN": "output"
  3183. },
  3184. "connections": {
  3185. "DST": [ 32 ],
  3186. "DST_EN": [ "1" ],
  3187. "SRC": [ 34 ],
  3188. "SRC_EN": [ "1" ]
  3189. }
  3190. },
  3191. "$specify$2649": {
  3192. "hide_name": 1,
  3193. "type": "$specify3",
  3194. "parameters": {
  3195. "DAT_DST_PEN": "0",
  3196. "DAT_DST_POL": "0",
  3197. "DST_WIDTH": "00000000000000000000000000010000",
  3198. "EDGE_EN": "1",
  3199. "EDGE_POL": "1",
  3200. "FULL": "1",
  3201. "SRC_DST_PEN": "0",
  3202. "SRC_DST_POL": "0",
  3203. "SRC_WIDTH": "00000000000000000000000000000001",
  3204. "T_FALL_MAX": "00000000000000000000010010011011",
  3205. "T_FALL_MIN": "00000000000000000000010010011011",
  3206. "T_FALL_TYP": "00000000000000000000010010011011",
  3207. "T_RISE_MAX": "00000000000000000000010010011011",
  3208. "T_RISE_MIN": "00000000000000000000010010011011",
  3209. "T_RISE_TYP": "00000000000000000000010010011011"
  3210. },
  3211. "attributes": {
  3212. "module_not_derived": "00000000000000000000000000000001",
  3213. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1721.3-1721.44"
  3214. },
  3215. "port_directions": {
  3216. "DAT": "input",
  3217. "DST": "input",
  3218. "EN": "input",
  3219. "SRC": "input"
  3220. },
  3221. "connections": {
  3222. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  3223. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  3224. "EN": [ "1" ],
  3225. "SRC": [ 18 ]
  3226. }
  3227. }
  3228. },
  3229. "netnames": {
  3230. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43686_Y": {
  3231. "hide_name": 1,
  3232. "bits": [ 78 ],
  3233. "attributes": {
  3234. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  3235. }
  3236. },
  3237. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43687_Y": {
  3238. "hide_name": 1,
  3239. "bits": [ 79 ],
  3240. "attributes": {
  3241. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  3242. }
  3243. },
  3244. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43688_Y": {
  3245. "hide_name": 1,
  3246. "bits": [ 80 ],
  3247. "attributes": {
  3248. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  3249. }
  3250. },
  3251. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43689_Y": {
  3252. "hide_name": 1,
  3253. "bits": [ 81 ],
  3254. "attributes": {
  3255. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  3256. }
  3257. },
  3258. "MASK": {
  3259. "hide_name": 0,
  3260. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  3261. "attributes": {
  3262. "defaultvalue": "0000000000000000",
  3263. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  3264. }
  3265. },
  3266. "RADDR": {
  3267. "hide_name": 0,
  3268. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  3269. "attributes": {
  3270. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1492.16-1492.21"
  3271. }
  3272. },
  3273. "RCLK": {
  3274. "hide_name": 0,
  3275. "bits": [ 18 ],
  3276. "attributes": {
  3277. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1489.16-1489.20"
  3278. }
  3279. },
  3280. "RCLKE": {
  3281. "hide_name": 0,
  3282. "bits": [ 19 ],
  3283. "attributes": {
  3284. "defaultvalue": "1",
  3285. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1490.16-1490.21"
  3286. }
  3287. },
  3288. "RDATA": {
  3289. "hide_name": 0,
  3290. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  3291. "attributes": {
  3292. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21"
  3293. }
  3294. },
  3295. "RE": {
  3296. "hide_name": 0,
  3297. "bits": [ 20 ],
  3298. "attributes": {
  3299. "defaultvalue": "0",
  3300. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1491.16-1491.18"
  3301. }
  3302. },
  3303. "WADDR": {
  3304. "hide_name": 0,
  3305. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  3306. "attributes": {
  3307. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1496.16-1496.21"
  3308. }
  3309. },
  3310. "WCLK": {
  3311. "hide_name": 0,
  3312. "bits": [ 32 ],
  3313. "attributes": {
  3314. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1493.16-1493.20"
  3315. }
  3316. },
  3317. "WCLKE": {
  3318. "hide_name": 0,
  3319. "bits": [ 33 ],
  3320. "attributes": {
  3321. "defaultvalue": "1",
  3322. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  3323. }
  3324. },
  3325. "WDATA": {
  3326. "hide_name": 0,
  3327. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  3328. "attributes": {
  3329. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1498.16-1498.21"
  3330. }
  3331. },
  3332. "WE": {
  3333. "hide_name": 0,
  3334. "bits": [ 34 ],
  3335. "attributes": {
  3336. "defaultvalue": "0",
  3337. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1495.16-1495.18"
  3338. }
  3339. }
  3340. }
  3341. },
  3342. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000010001111": {
  3343. "attributes": {
  3344. "blackbox": "00000000000000000000000000000001",
  3345. "hdlname": "__ABC9_DELAY",
  3346. "cells_not_processed": "00000000000000000000000000000001",
  3347. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3348. },
  3349. "parameter_default_values": {
  3350. "DELAY": "00000000000000000000000010001111"
  3351. },
  3352. "ports": {
  3353. "I": {
  3354. "direction": "input",
  3355. "bits": [ 2 ]
  3356. },
  3357. "O": {
  3358. "direction": "output",
  3359. "bits": [ 3 ]
  3360. }
  3361. },
  3362. "cells": {
  3363. "$specify$44122": {
  3364. "hide_name": 1,
  3365. "type": "$specify2",
  3366. "parameters": {
  3367. "DST_WIDTH": "00000000000000000000000000000001",
  3368. "FULL": "0",
  3369. "SRC_DST_PEN": "0",
  3370. "SRC_DST_POL": "0",
  3371. "SRC_WIDTH": "00000000000000000000000000000001",
  3372. "T_FALL_MAX": "00000000000000000000000010001111",
  3373. "T_FALL_MIN": "00000000000000000000000010001111",
  3374. "T_FALL_TYP": "00000000000000000000000010001111",
  3375. "T_RISE_MAX": "00000000000000000000000010001111",
  3376. "T_RISE_MIN": "00000000000000000000000010001111",
  3377. "T_RISE_TYP": "00000000000000000000000010001111"
  3378. },
  3379. "attributes": {
  3380. "module_not_derived": "00000000000000000000000000000001",
  3381. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3382. },
  3383. "port_directions": {
  3384. "DST": "input",
  3385. "EN": "input",
  3386. "SRC": "input"
  3387. },
  3388. "connections": {
  3389. "DST": [ 3 ],
  3390. "EN": [ "1" ],
  3391. "SRC": [ 2 ]
  3392. }
  3393. }
  3394. },
  3395. "netnames": {
  3396. "I": {
  3397. "hide_name": 0,
  3398. "bits": [ 2 ],
  3399. "attributes": {
  3400. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3401. }
  3402. },
  3403. "O": {
  3404. "hide_name": 0,
  3405. "bits": [ 3 ],
  3406. "attributes": {
  3407. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3408. }
  3409. }
  3410. }
  3411. },
  3412. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000010111001": {
  3413. "attributes": {
  3414. "blackbox": "00000000000000000000000000000001",
  3415. "hdlname": "__ABC9_DELAY",
  3416. "cells_not_processed": "00000000000000000000000000000001",
  3417. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3418. },
  3419. "parameter_default_values": {
  3420. "DELAY": "00000000000000000000000010111001"
  3421. },
  3422. "ports": {
  3423. "I": {
  3424. "direction": "input",
  3425. "bits": [ 2 ]
  3426. },
  3427. "O": {
  3428. "direction": "output",
  3429. "bits": [ 3 ]
  3430. }
  3431. },
  3432. "cells": {
  3433. "$specify$44122": {
  3434. "hide_name": 1,
  3435. "type": "$specify2",
  3436. "parameters": {
  3437. "DST_WIDTH": "00000000000000000000000000000001",
  3438. "FULL": "0",
  3439. "SRC_DST_PEN": "0",
  3440. "SRC_DST_POL": "0",
  3441. "SRC_WIDTH": "00000000000000000000000000000001",
  3442. "T_FALL_MAX": "00000000000000000000000010111001",
  3443. "T_FALL_MIN": "00000000000000000000000010111001",
  3444. "T_FALL_TYP": "00000000000000000000000010111001",
  3445. "T_RISE_MAX": "00000000000000000000000010111001",
  3446. "T_RISE_MIN": "00000000000000000000000010111001",
  3447. "T_RISE_TYP": "00000000000000000000000010111001"
  3448. },
  3449. "attributes": {
  3450. "module_not_derived": "00000000000000000000000000000001",
  3451. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3452. },
  3453. "port_directions": {
  3454. "DST": "input",
  3455. "EN": "input",
  3456. "SRC": "input"
  3457. },
  3458. "connections": {
  3459. "DST": [ 3 ],
  3460. "EN": [ "1" ],
  3461. "SRC": [ 2 ]
  3462. }
  3463. }
  3464. },
  3465. "netnames": {
  3466. "I": {
  3467. "hide_name": 0,
  3468. "bits": [ 2 ],
  3469. "attributes": {
  3470. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3471. }
  3472. },
  3473. "O": {
  3474. "hide_name": 0,
  3475. "bits": [ 3 ],
  3476. "attributes": {
  3477. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3478. }
  3479. }
  3480. }
  3481. },
  3482. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000011111100": {
  3483. "attributes": {
  3484. "blackbox": "00000000000000000000000000000001",
  3485. "hdlname": "__ABC9_DELAY",
  3486. "cells_not_processed": "00000000000000000000000000000001",
  3487. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3488. },
  3489. "parameter_default_values": {
  3490. "DELAY": "00000000000000000000000011111100"
  3491. },
  3492. "ports": {
  3493. "I": {
  3494. "direction": "input",
  3495. "bits": [ 2 ]
  3496. },
  3497. "O": {
  3498. "direction": "output",
  3499. "bits": [ 3 ]
  3500. }
  3501. },
  3502. "cells": {
  3503. "$specify$44122": {
  3504. "hide_name": 1,
  3505. "type": "$specify2",
  3506. "parameters": {
  3507. "DST_WIDTH": "00000000000000000000000000000001",
  3508. "FULL": "0",
  3509. "SRC_DST_PEN": "0",
  3510. "SRC_DST_POL": "0",
  3511. "SRC_WIDTH": "00000000000000000000000000000001",
  3512. "T_FALL_MAX": "00000000000000000000000011111100",
  3513. "T_FALL_MIN": "00000000000000000000000011111100",
  3514. "T_FALL_TYP": "00000000000000000000000011111100",
  3515. "T_RISE_MAX": "00000000000000000000000011111100",
  3516. "T_RISE_MIN": "00000000000000000000000011111100",
  3517. "T_RISE_TYP": "00000000000000000000000011111100"
  3518. },
  3519. "attributes": {
  3520. "module_not_derived": "00000000000000000000000000000001",
  3521. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3522. },
  3523. "port_directions": {
  3524. "DST": "input",
  3525. "EN": "input",
  3526. "SRC": "input"
  3527. },
  3528. "connections": {
  3529. "DST": [ 3 ],
  3530. "EN": [ "1" ],
  3531. "SRC": [ 2 ]
  3532. }
  3533. }
  3534. },
  3535. "netnames": {
  3536. "I": {
  3537. "hide_name": 0,
  3538. "bits": [ 2 ],
  3539. "attributes": {
  3540. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3541. }
  3542. },
  3543. "O": {
  3544. "hide_name": 0,
  3545. "bits": [ 3 ],
  3546. "attributes": {
  3547. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3548. }
  3549. }
  3550. }
  3551. },
  3552. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000100001100": {
  3553. "attributes": {
  3554. "blackbox": "00000000000000000000000000000001",
  3555. "hdlname": "__ABC9_DELAY",
  3556. "cells_not_processed": "00000000000000000000000000000001",
  3557. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3558. },
  3559. "parameter_default_values": {
  3560. "DELAY": "00000000000000000000000100001100"
  3561. },
  3562. "ports": {
  3563. "I": {
  3564. "direction": "input",
  3565. "bits": [ 2 ]
  3566. },
  3567. "O": {
  3568. "direction": "output",
  3569. "bits": [ 3 ]
  3570. }
  3571. },
  3572. "cells": {
  3573. "$specify$44122": {
  3574. "hide_name": 1,
  3575. "type": "$specify2",
  3576. "parameters": {
  3577. "DST_WIDTH": "00000000000000000000000000000001",
  3578. "FULL": "0",
  3579. "SRC_DST_PEN": "0",
  3580. "SRC_DST_POL": "0",
  3581. "SRC_WIDTH": "00000000000000000000000000000001",
  3582. "T_FALL_MAX": "00000000000000000000000100001100",
  3583. "T_FALL_MIN": "00000000000000000000000100001100",
  3584. "T_FALL_TYP": "00000000000000000000000100001100",
  3585. "T_RISE_MAX": "00000000000000000000000100001100",
  3586. "T_RISE_MIN": "00000000000000000000000100001100",
  3587. "T_RISE_TYP": "00000000000000000000000100001100"
  3588. },
  3589. "attributes": {
  3590. "module_not_derived": "00000000000000000000000000000001",
  3591. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3592. },
  3593. "port_directions": {
  3594. "DST": "input",
  3595. "EN": "input",
  3596. "SRC": "input"
  3597. },
  3598. "connections": {
  3599. "DST": [ 3 ],
  3600. "EN": [ "1" ],
  3601. "SRC": [ 2 ]
  3602. }
  3603. }
  3604. },
  3605. "netnames": {
  3606. "I": {
  3607. "hide_name": 0,
  3608. "bits": [ 2 ],
  3609. "attributes": {
  3610. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3611. }
  3612. },
  3613. "O": {
  3614. "hide_name": 0,
  3615. "bits": [ 3 ],
  3616. "attributes": {
  3617. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3618. }
  3619. }
  3620. }
  3621. },
  3622. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000100100001": {
  3623. "attributes": {
  3624. "blackbox": "00000000000000000000000000000001",
  3625. "hdlname": "__ABC9_DELAY",
  3626. "cells_not_processed": "00000000000000000000000000000001",
  3627. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3628. },
  3629. "parameter_default_values": {
  3630. "DELAY": "00000000000000000000000100100001"
  3631. },
  3632. "ports": {
  3633. "I": {
  3634. "direction": "input",
  3635. "bits": [ 2 ]
  3636. },
  3637. "O": {
  3638. "direction": "output",
  3639. "bits": [ 3 ]
  3640. }
  3641. },
  3642. "cells": {
  3643. "$specify$44122": {
  3644. "hide_name": 1,
  3645. "type": "$specify2",
  3646. "parameters": {
  3647. "DST_WIDTH": "00000000000000000000000000000001",
  3648. "FULL": "0",
  3649. "SRC_DST_PEN": "0",
  3650. "SRC_DST_POL": "0",
  3651. "SRC_WIDTH": "00000000000000000000000000000001",
  3652. "T_FALL_MAX": "00000000000000000000000100100001",
  3653. "T_FALL_MIN": "00000000000000000000000100100001",
  3654. "T_FALL_TYP": "00000000000000000000000100100001",
  3655. "T_RISE_MAX": "00000000000000000000000100100001",
  3656. "T_RISE_MIN": "00000000000000000000000100100001",
  3657. "T_RISE_TYP": "00000000000000000000000100100001"
  3658. },
  3659. "attributes": {
  3660. "module_not_derived": "00000000000000000000000000000001",
  3661. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3662. },
  3663. "port_directions": {
  3664. "DST": "input",
  3665. "EN": "input",
  3666. "SRC": "input"
  3667. },
  3668. "connections": {
  3669. "DST": [ 3 ],
  3670. "EN": [ "1" ],
  3671. "SRC": [ 2 ]
  3672. }
  3673. }
  3674. },
  3675. "netnames": {
  3676. "I": {
  3677. "hide_name": 0,
  3678. "bits": [ 2 ],
  3679. "attributes": {
  3680. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3681. }
  3682. },
  3683. "O": {
  3684. "hide_name": 0,
  3685. "bits": [ 3 ],
  3686. "attributes": {
  3687. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3688. }
  3689. }
  3690. }
  3691. },
  3692. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000100110001": {
  3693. "attributes": {
  3694. "blackbox": "00000000000000000000000000000001",
  3695. "hdlname": "__ABC9_DELAY",
  3696. "cells_not_processed": "00000000000000000000000000000001",
  3697. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3698. },
  3699. "parameter_default_values": {
  3700. "DELAY": "00000000000000000000000100110001"
  3701. },
  3702. "ports": {
  3703. "I": {
  3704. "direction": "input",
  3705. "bits": [ 2 ]
  3706. },
  3707. "O": {
  3708. "direction": "output",
  3709. "bits": [ 3 ]
  3710. }
  3711. },
  3712. "cells": {
  3713. "$specify$44122": {
  3714. "hide_name": 1,
  3715. "type": "$specify2",
  3716. "parameters": {
  3717. "DST_WIDTH": "00000000000000000000000000000001",
  3718. "FULL": "0",
  3719. "SRC_DST_PEN": "0",
  3720. "SRC_DST_POL": "0",
  3721. "SRC_WIDTH": "00000000000000000000000000000001",
  3722. "T_FALL_MAX": "00000000000000000000000100110001",
  3723. "T_FALL_MIN": "00000000000000000000000100110001",
  3724. "T_FALL_TYP": "00000000000000000000000100110001",
  3725. "T_RISE_MAX": "00000000000000000000000100110001",
  3726. "T_RISE_MIN": "00000000000000000000000100110001",
  3727. "T_RISE_TYP": "00000000000000000000000100110001"
  3728. },
  3729. "attributes": {
  3730. "module_not_derived": "00000000000000000000000000000001",
  3731. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3732. },
  3733. "port_directions": {
  3734. "DST": "input",
  3735. "EN": "input",
  3736. "SRC": "input"
  3737. },
  3738. "connections": {
  3739. "DST": [ 3 ],
  3740. "EN": [ "1" ],
  3741. "SRC": [ 2 ]
  3742. }
  3743. }
  3744. },
  3745. "netnames": {
  3746. "I": {
  3747. "hide_name": 0,
  3748. "bits": [ 2 ],
  3749. "attributes": {
  3750. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3751. }
  3752. },
  3753. "O": {
  3754. "hide_name": 0,
  3755. "bits": [ 3 ],
  3756. "attributes": {
  3757. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3758. }
  3759. }
  3760. }
  3761. },
  3762. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000110000000": {
  3763. "attributes": {
  3764. "blackbox": "00000000000000000000000000000001",
  3765. "hdlname": "__ABC9_DELAY",
  3766. "cells_not_processed": "00000000000000000000000000000001",
  3767. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3768. },
  3769. "parameter_default_values": {
  3770. "DELAY": "00000000000000000000000110000000"
  3771. },
  3772. "ports": {
  3773. "I": {
  3774. "direction": "input",
  3775. "bits": [ 2 ]
  3776. },
  3777. "O": {
  3778. "direction": "output",
  3779. "bits": [ 3 ]
  3780. }
  3781. },
  3782. "cells": {
  3783. "$specify$44122": {
  3784. "hide_name": 1,
  3785. "type": "$specify2",
  3786. "parameters": {
  3787. "DST_WIDTH": "00000000000000000000000000000001",
  3788. "FULL": "0",
  3789. "SRC_DST_PEN": "0",
  3790. "SRC_DST_POL": "0",
  3791. "SRC_WIDTH": "00000000000000000000000000000001",
  3792. "T_FALL_MAX": "00000000000000000000000110000000",
  3793. "T_FALL_MIN": "00000000000000000000000110000000",
  3794. "T_FALL_TYP": "00000000000000000000000110000000",
  3795. "T_RISE_MAX": "00000000000000000000000110000000",
  3796. "T_RISE_MIN": "00000000000000000000000110000000",
  3797. "T_RISE_TYP": "00000000000000000000000110000000"
  3798. },
  3799. "attributes": {
  3800. "module_not_derived": "00000000000000000000000000000001",
  3801. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3802. },
  3803. "port_directions": {
  3804. "DST": "input",
  3805. "EN": "input",
  3806. "SRC": "input"
  3807. },
  3808. "connections": {
  3809. "DST": [ 3 ],
  3810. "EN": [ "1" ],
  3811. "SRC": [ 2 ]
  3812. }
  3813. }
  3814. },
  3815. "netnames": {
  3816. "I": {
  3817. "hide_name": 0,
  3818. "bits": [ 2 ],
  3819. "attributes": {
  3820. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3821. }
  3822. },
  3823. "O": {
  3824. "hide_name": 0,
  3825. "bits": [ 3 ],
  3826. "attributes": {
  3827. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3828. }
  3829. }
  3830. }
  3831. },
  3832. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000110010100": {
  3833. "attributes": {
  3834. "blackbox": "00000000000000000000000000000001",
  3835. "hdlname": "__ABC9_DELAY",
  3836. "cells_not_processed": "00000000000000000000000000000001",
  3837. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3838. },
  3839. "parameter_default_values": {
  3840. "DELAY": "00000000000000000000000110010100"
  3841. },
  3842. "ports": {
  3843. "I": {
  3844. "direction": "input",
  3845. "bits": [ 2 ]
  3846. },
  3847. "O": {
  3848. "direction": "output",
  3849. "bits": [ 3 ]
  3850. }
  3851. },
  3852. "cells": {
  3853. "$specify$44122": {
  3854. "hide_name": 1,
  3855. "type": "$specify2",
  3856. "parameters": {
  3857. "DST_WIDTH": "00000000000000000000000000000001",
  3858. "FULL": "0",
  3859. "SRC_DST_PEN": "0",
  3860. "SRC_DST_POL": "0",
  3861. "SRC_WIDTH": "00000000000000000000000000000001",
  3862. "T_FALL_MAX": "00000000000000000000000110010100",
  3863. "T_FALL_MIN": "00000000000000000000000110010100",
  3864. "T_FALL_TYP": "00000000000000000000000110010100",
  3865. "T_RISE_MAX": "00000000000000000000000110010100",
  3866. "T_RISE_MIN": "00000000000000000000000110010100",
  3867. "T_RISE_TYP": "00000000000000000000000110010100"
  3868. },
  3869. "attributes": {
  3870. "module_not_derived": "00000000000000000000000000000001",
  3871. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3872. },
  3873. "port_directions": {
  3874. "DST": "input",
  3875. "EN": "input",
  3876. "SRC": "input"
  3877. },
  3878. "connections": {
  3879. "DST": [ 3 ],
  3880. "EN": [ "1" ],
  3881. "SRC": [ 2 ]
  3882. }
  3883. }
  3884. },
  3885. "netnames": {
  3886. "I": {
  3887. "hide_name": 0,
  3888. "bits": [ 2 ],
  3889. "attributes": {
  3890. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3891. }
  3892. },
  3893. "O": {
  3894. "hide_name": 0,
  3895. "bits": [ 3 ],
  3896. "attributes": {
  3897. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3898. }
  3899. }
  3900. }
  3901. },
  3902. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000110101000": {
  3903. "attributes": {
  3904. "blackbox": "00000000000000000000000000000001",
  3905. "hdlname": "__ABC9_DELAY",
  3906. "cells_not_processed": "00000000000000000000000000000001",
  3907. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3908. },
  3909. "parameter_default_values": {
  3910. "DELAY": "00000000000000000000000110101000"
  3911. },
  3912. "ports": {
  3913. "I": {
  3914. "direction": "input",
  3915. "bits": [ 2 ]
  3916. },
  3917. "O": {
  3918. "direction": "output",
  3919. "bits": [ 3 ]
  3920. }
  3921. },
  3922. "cells": {
  3923. "$specify$44122": {
  3924. "hide_name": 1,
  3925. "type": "$specify2",
  3926. "parameters": {
  3927. "DST_WIDTH": "00000000000000000000000000000001",
  3928. "FULL": "0",
  3929. "SRC_DST_PEN": "0",
  3930. "SRC_DST_POL": "0",
  3931. "SRC_WIDTH": "00000000000000000000000000000001",
  3932. "T_FALL_MAX": "00000000000000000000000110101000",
  3933. "T_FALL_MIN": "00000000000000000000000110101000",
  3934. "T_FALL_TYP": "00000000000000000000000110101000",
  3935. "T_RISE_MAX": "00000000000000000000000110101000",
  3936. "T_RISE_MIN": "00000000000000000000000110101000",
  3937. "T_RISE_TYP": "00000000000000000000000110101000"
  3938. },
  3939. "attributes": {
  3940. "module_not_derived": "00000000000000000000000000000001",
  3941. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  3942. },
  3943. "port_directions": {
  3944. "DST": "input",
  3945. "EN": "input",
  3946. "SRC": "input"
  3947. },
  3948. "connections": {
  3949. "DST": [ 3 ],
  3950. "EN": [ "1" ],
  3951. "SRC": [ 2 ]
  3952. }
  3953. }
  3954. },
  3955. "netnames": {
  3956. "I": {
  3957. "hide_name": 0,
  3958. "bits": [ 2 ],
  3959. "attributes": {
  3960. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  3961. }
  3962. },
  3963. "O": {
  3964. "hide_name": 0,
  3965. "bits": [ 3 ],
  3966. "attributes": {
  3967. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  3968. }
  3969. }
  3970. }
  3971. },
  3972. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000000111110111": {
  3973. "attributes": {
  3974. "blackbox": "00000000000000000000000000000001",
  3975. "hdlname": "__ABC9_DELAY",
  3976. "cells_not_processed": "00000000000000000000000000000001",
  3977. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  3978. },
  3979. "parameter_default_values": {
  3980. "DELAY": "00000000000000000000000111110111"
  3981. },
  3982. "ports": {
  3983. "I": {
  3984. "direction": "input",
  3985. "bits": [ 2 ]
  3986. },
  3987. "O": {
  3988. "direction": "output",
  3989. "bits": [ 3 ]
  3990. }
  3991. },
  3992. "cells": {
  3993. "$specify$44122": {
  3994. "hide_name": 1,
  3995. "type": "$specify2",
  3996. "parameters": {
  3997. "DST_WIDTH": "00000000000000000000000000000001",
  3998. "FULL": "0",
  3999. "SRC_DST_PEN": "0",
  4000. "SRC_DST_POL": "0",
  4001. "SRC_WIDTH": "00000000000000000000000000000001",
  4002. "T_FALL_MAX": "00000000000000000000000111110111",
  4003. "T_FALL_MIN": "00000000000000000000000111110111",
  4004. "T_FALL_TYP": "00000000000000000000000111110111",
  4005. "T_RISE_MAX": "00000000000000000000000111110111",
  4006. "T_RISE_MIN": "00000000000000000000000111110111",
  4007. "T_RISE_TYP": "00000000000000000000000111110111"
  4008. },
  4009. "attributes": {
  4010. "module_not_derived": "00000000000000000000000000000001",
  4011. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  4012. },
  4013. "port_directions": {
  4014. "DST": "input",
  4015. "EN": "input",
  4016. "SRC": "input"
  4017. },
  4018. "connections": {
  4019. "DST": [ 3 ],
  4020. "EN": [ "1" ],
  4021. "SRC": [ 2 ]
  4022. }
  4023. }
  4024. },
  4025. "netnames": {
  4026. "I": {
  4027. "hide_name": 0,
  4028. "bits": [ 2 ],
  4029. "attributes": {
  4030. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  4031. }
  4032. },
  4033. "O": {
  4034. "hide_name": 0,
  4035. "bits": [ 3 ],
  4036. "attributes": {
  4037. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  4038. }
  4039. }
  4040. }
  4041. },
  4042. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000001000000101": {
  4043. "attributes": {
  4044. "blackbox": "00000000000000000000000000000001",
  4045. "hdlname": "__ABC9_DELAY",
  4046. "cells_not_processed": "00000000000000000000000000000001",
  4047. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  4048. },
  4049. "parameter_default_values": {
  4050. "DELAY": "00000000000000000000001000000101"
  4051. },
  4052. "ports": {
  4053. "I": {
  4054. "direction": "input",
  4055. "bits": [ 2 ]
  4056. },
  4057. "O": {
  4058. "direction": "output",
  4059. "bits": [ 3 ]
  4060. }
  4061. },
  4062. "cells": {
  4063. "$specify$44122": {
  4064. "hide_name": 1,
  4065. "type": "$specify2",
  4066. "parameters": {
  4067. "DST_WIDTH": "00000000000000000000000000000001",
  4068. "FULL": "0",
  4069. "SRC_DST_PEN": "0",
  4070. "SRC_DST_POL": "0",
  4071. "SRC_WIDTH": "00000000000000000000000000000001",
  4072. "T_FALL_MAX": "00000000000000000000001000000101",
  4073. "T_FALL_MIN": "00000000000000000000001000000101",
  4074. "T_FALL_TYP": "00000000000000000000001000000101",
  4075. "T_RISE_MAX": "00000000000000000000001000000101",
  4076. "T_RISE_MIN": "00000000000000000000001000000101",
  4077. "T_RISE_TYP": "00000000000000000000001000000101"
  4078. },
  4079. "attributes": {
  4080. "module_not_derived": "00000000000000000000000000000001",
  4081. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  4082. },
  4083. "port_directions": {
  4084. "DST": "input",
  4085. "EN": "input",
  4086. "SRC": "input"
  4087. },
  4088. "connections": {
  4089. "DST": [ 3 ],
  4090. "EN": [ "1" ],
  4091. "SRC": [ 2 ]
  4092. }
  4093. }
  4094. },
  4095. "netnames": {
  4096. "I": {
  4097. "hide_name": 0,
  4098. "bits": [ 2 ],
  4099. "attributes": {
  4100. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  4101. }
  4102. },
  4103. "O": {
  4104. "hide_name": 0,
  4105. "bits": [ 3 ],
  4106. "attributes": {
  4107. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  4108. }
  4109. }
  4110. }
  4111. },
  4112. "$paramod$__ABC9_DELAY\\DELAY=32'00000000000000000000001000010010": {
  4113. "attributes": {
  4114. "blackbox": "00000000000000000000000000000001",
  4115. "hdlname": "__ABC9_DELAY",
  4116. "cells_not_processed": "00000000000000000000000000000001",
  4117. "src": "/usr/bin/../share/yosys/abc9_model.v:2.1-7.10"
  4118. },
  4119. "parameter_default_values": {
  4120. "DELAY": "00000000000000000000001000010010"
  4121. },
  4122. "ports": {
  4123. "I": {
  4124. "direction": "input",
  4125. "bits": [ 2 ]
  4126. },
  4127. "O": {
  4128. "direction": "output",
  4129. "bits": [ 3 ]
  4130. }
  4131. },
  4132. "cells": {
  4133. "$specify$44122": {
  4134. "hide_name": 1,
  4135. "type": "$specify2",
  4136. "parameters": {
  4137. "DST_WIDTH": "00000000000000000000000000000001",
  4138. "FULL": "0",
  4139. "SRC_DST_PEN": "0",
  4140. "SRC_DST_POL": "0",
  4141. "SRC_WIDTH": "00000000000000000000000000000001",
  4142. "T_FALL_MAX": "00000000000000000000001000010010",
  4143. "T_FALL_MIN": "00000000000000000000001000010010",
  4144. "T_FALL_TYP": "00000000000000000000001000010010",
  4145. "T_RISE_MAX": "00000000000000000000001000010010",
  4146. "T_RISE_MIN": "00000000000000000000001000010010",
  4147. "T_RISE_TYP": "00000000000000000000001000010010"
  4148. },
  4149. "attributes": {
  4150. "module_not_derived": "00000000000000000000000000000001",
  4151. "src": "/usr/bin/../share/yosys/abc9_model.v:5.5-5.22"
  4152. },
  4153. "port_directions": {
  4154. "DST": "input",
  4155. "EN": "input",
  4156. "SRC": "input"
  4157. },
  4158. "connections": {
  4159. "DST": [ 3 ],
  4160. "EN": [ "1" ],
  4161. "SRC": [ 2 ]
  4162. }
  4163. }
  4164. },
  4165. "netnames": {
  4166. "I": {
  4167. "hide_name": 0,
  4168. "bits": [ 2 ],
  4169. "attributes": {
  4170. "src": "/usr/bin/../share/yosys/abc9_model.v:2.29-2.30"
  4171. }
  4172. },
  4173. "O": {
  4174. "hide_name": 0,
  4175. "bits": [ 3 ],
  4176. "attributes": {
  4177. "src": "/usr/bin/../share/yosys/abc9_model.v:2.39-2.40"
  4178. }
  4179. }
  4180. }
  4181. },
  4182. "$paramod$__ICE40_CARRY_WRAPPER\\LUT=16'0110100110010110\\I3_IS_CI=1'1": {
  4183. "attributes": {
  4184. "hdlname": "__ICE40_CARRY_WRAPPER",
  4185. "blackbox": "00000000000000000000000000000001",
  4186. "cells_not_processed": "00000000000000000000000000000001",
  4187. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:2.1-86.10"
  4188. },
  4189. "parameter_default_values": {
  4190. "I3_IS_CI": "1",
  4191. "LUT": "0110100110010110"
  4192. },
  4193. "ports": {
  4194. "CO": {
  4195. "direction": "output",
  4196. "bits": [ 2 ]
  4197. },
  4198. "O": {
  4199. "direction": "output",
  4200. "bits": [ 3 ]
  4201. },
  4202. "A": {
  4203. "direction": "input",
  4204. "bits": [ 4 ]
  4205. },
  4206. "B": {
  4207. "direction": "input",
  4208. "bits": [ 5 ]
  4209. },
  4210. "CI": {
  4211. "direction": "input",
  4212. "bits": [ 6 ]
  4213. },
  4214. "I0": {
  4215. "direction": "input",
  4216. "bits": [ 7 ]
  4217. },
  4218. "I3": {
  4219. "direction": "input",
  4220. "bits": [ 8 ]
  4221. }
  4222. },
  4223. "cells": {
  4224. },
  4225. "netnames": {
  4226. "A": {
  4227. "hide_name": 0,
  4228. "bits": [ 4 ],
  4229. "attributes": {
  4230. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:6.8-6.9"
  4231. }
  4232. },
  4233. "B": {
  4234. "hide_name": 0,
  4235. "bits": [ 5 ],
  4236. "attributes": {
  4237. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:6.11-6.12"
  4238. }
  4239. },
  4240. "CI": {
  4241. "hide_name": 0,
  4242. "bits": [ 6 ],
  4243. "attributes": {
  4244. "abc9_carry": "00000000000000000000000000000001",
  4245. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  4246. }
  4247. },
  4248. "CO": {
  4249. "hide_name": 0,
  4250. "bits": [ 2 ],
  4251. "attributes": {
  4252. "abc9_carry": "00000000000000000000000000000001",
  4253. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  4254. }
  4255. },
  4256. "I0": {
  4257. "hide_name": 0,
  4258. "bits": [ 7 ],
  4259. "attributes": {
  4260. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:9.8-9.10"
  4261. }
  4262. },
  4263. "I3": {
  4264. "hide_name": 0,
  4265. "bits": [ 8 ],
  4266. "attributes": {
  4267. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:9.12-9.14"
  4268. }
  4269. },
  4270. "O": {
  4271. "hide_name": 0,
  4272. "bits": [ 3 ],
  4273. "attributes": {
  4274. "src": "/usr/bin/../share/yosys/ice40/abc9_model.v:5.9-5.10"
  4275. }
  4276. }
  4277. }
  4278. },
  4279. "$paramod$ba68a0420314c29d51ab7ddbd2ec9361aa29f018\\SB_RAM40_4K": {
  4280. "attributes": {
  4281. "hdlname": "SB_RAM40_4K",
  4282. "blackbox": "00000000000000000000000000000001",
  4283. "cells_not_processed": "00000000000000000000000000000001",
  4284. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1487.1-1724.10"
  4285. },
  4286. "parameter_default_values": {
  4287. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4288. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4289. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4290. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4291. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4292. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4293. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4294. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4295. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4296. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4297. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4298. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4299. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4300. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4301. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4302. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  4303. "INIT_FILE": " ",
  4304. "READ_MODE": "01",
  4305. "WRITE_MODE": "01"
  4306. },
  4307. "ports": {
  4308. "RDATA": {
  4309. "direction": "output",
  4310. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  4311. },
  4312. "RCLK": {
  4313. "direction": "input",
  4314. "bits": [ 18 ]
  4315. },
  4316. "RCLKE": {
  4317. "direction": "input",
  4318. "bits": [ 19 ]
  4319. },
  4320. "RE": {
  4321. "direction": "input",
  4322. "bits": [ 20 ]
  4323. },
  4324. "RADDR": {
  4325. "direction": "input",
  4326. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  4327. },
  4328. "WCLK": {
  4329. "direction": "input",
  4330. "bits": [ 32 ]
  4331. },
  4332. "WCLKE": {
  4333. "direction": "input",
  4334. "bits": [ 33 ]
  4335. },
  4336. "WE": {
  4337. "direction": "input",
  4338. "bits": [ 34 ]
  4339. },
  4340. "WADDR": {
  4341. "direction": "input",
  4342. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  4343. },
  4344. "MASK": {
  4345. "direction": "input",
  4346. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  4347. },
  4348. "WDATA": {
  4349. "direction": "input",
  4350. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  4351. }
  4352. },
  4353. "cells": {
  4354. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43674": {
  4355. "hide_name": 1,
  4356. "type": "$logic_and",
  4357. "parameters": {
  4358. "A_SIGNED": "00000000000000000000000000000000",
  4359. "A_WIDTH": "00000000000000000000000000000001",
  4360. "B_SIGNED": "00000000000000000000000000000000",
  4361. "B_WIDTH": "00000000000000000000000000000001",
  4362. "Y_WIDTH": "00000000000000000000000000000001"
  4363. },
  4364. "attributes": {
  4365. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  4366. },
  4367. "port_directions": {
  4368. "A": "input",
  4369. "B": "input",
  4370. "Y": "output"
  4371. },
  4372. "connections": {
  4373. "A": [ 34 ],
  4374. "B": [ 33 ],
  4375. "Y": [ 78 ]
  4376. }
  4377. },
  4378. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43675": {
  4379. "hide_name": 1,
  4380. "type": "$logic_and",
  4381. "parameters": {
  4382. "A_SIGNED": "00000000000000000000000000000000",
  4383. "A_WIDTH": "00000000000000000000000000000001",
  4384. "B_SIGNED": "00000000000000000000000000000000",
  4385. "B_WIDTH": "00000000000000000000000000000001",
  4386. "Y_WIDTH": "00000000000000000000000000000001"
  4387. },
  4388. "attributes": {
  4389. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  4390. },
  4391. "port_directions": {
  4392. "A": "input",
  4393. "B": "input",
  4394. "Y": "output"
  4395. },
  4396. "connections": {
  4397. "A": [ 20 ],
  4398. "B": [ 19 ],
  4399. "Y": [ 79 ]
  4400. }
  4401. },
  4402. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43676": {
  4403. "hide_name": 1,
  4404. "type": "$logic_and",
  4405. "parameters": {
  4406. "A_SIGNED": "00000000000000000000000000000000",
  4407. "A_WIDTH": "00000000000000000000000000000001",
  4408. "B_SIGNED": "00000000000000000000000000000000",
  4409. "B_WIDTH": "00000000000000000000000000000001",
  4410. "Y_WIDTH": "00000000000000000000000000000001"
  4411. },
  4412. "attributes": {
  4413. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  4414. },
  4415. "port_directions": {
  4416. "A": "input",
  4417. "B": "input",
  4418. "Y": "output"
  4419. },
  4420. "connections": {
  4421. "A": [ 34 ],
  4422. "B": [ 33 ],
  4423. "Y": [ 80 ]
  4424. }
  4425. },
  4426. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43677": {
  4427. "hide_name": 1,
  4428. "type": "$logic_and",
  4429. "parameters": {
  4430. "A_SIGNED": "00000000000000000000000000000000",
  4431. "A_WIDTH": "00000000000000000000000000000001",
  4432. "B_SIGNED": "00000000000000000000000000000000",
  4433. "B_WIDTH": "00000000000000000000000000000001",
  4434. "Y_WIDTH": "00000000000000000000000000000001"
  4435. },
  4436. "attributes": {
  4437. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  4438. },
  4439. "port_directions": {
  4440. "A": "input",
  4441. "B": "input",
  4442. "Y": "output"
  4443. },
  4444. "connections": {
  4445. "A": [ 34 ],
  4446. "B": [ 33 ],
  4447. "Y": [ 81 ]
  4448. }
  4449. },
  4450. "$specify$2641": {
  4451. "hide_name": 1,
  4452. "type": "$specrule",
  4453. "parameters": {
  4454. "DST_PEN": "1",
  4455. "DST_POL": "1",
  4456. "DST_WIDTH": "00000000000000000000000000000001",
  4457. "SRC_PEN": "0",
  4458. "SRC_POL": "0",
  4459. "SRC_WIDTH": "00000000000000000000000000010000",
  4460. "TYPE": "$setup",
  4461. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4462. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4463. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4464. "T_LIMIT_MAX": "00000000000000000000001000000101",
  4465. "T_LIMIT_MIN": "00000000000000000000001000000101",
  4466. "T_LIMIT_TYP": "00000000000000000000001000000101"
  4467. },
  4468. "attributes": {
  4469. "module_not_derived": "00000000000000000000000000000001",
  4470. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.3-1705.51"
  4471. },
  4472. "port_directions": {
  4473. "DST": "input",
  4474. "DST_EN": "output",
  4475. "SRC": "input",
  4476. "SRC_EN": "output"
  4477. },
  4478. "connections": {
  4479. "DST": [ 32 ],
  4480. "DST_EN": [ 78 ],
  4481. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  4482. "SRC_EN": [ "1" ]
  4483. }
  4484. },
  4485. "$specify$2642": {
  4486. "hide_name": 1,
  4487. "type": "$specrule",
  4488. "parameters": {
  4489. "DST_PEN": "1",
  4490. "DST_POL": "1",
  4491. "DST_WIDTH": "00000000000000000000000000000001",
  4492. "SRC_PEN": "0",
  4493. "SRC_POL": "0",
  4494. "SRC_WIDTH": "00000000000000000000000000001011",
  4495. "TYPE": "$setup",
  4496. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4497. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4498. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4499. "T_LIMIT_MAX": "00000000000000000000000110000000",
  4500. "T_LIMIT_MIN": "00000000000000000000000110000000",
  4501. "T_LIMIT_TYP": "00000000000000000000000110000000"
  4502. },
  4503. "attributes": {
  4504. "module_not_derived": "00000000000000000000000000000001",
  4505. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.3-1707.52"
  4506. },
  4507. "port_directions": {
  4508. "DST": "input",
  4509. "DST_EN": "output",
  4510. "SRC": "input",
  4511. "SRC_EN": "output"
  4512. },
  4513. "connections": {
  4514. "DST": [ 18 ],
  4515. "DST_EN": [ 79 ],
  4516. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  4517. "SRC_EN": [ "1" ]
  4518. }
  4519. },
  4520. "$specify$2643": {
  4521. "hide_name": 1,
  4522. "type": "$specrule",
  4523. "parameters": {
  4524. "DST_PEN": "1",
  4525. "DST_POL": "1",
  4526. "DST_WIDTH": "00000000000000000000000000000001",
  4527. "SRC_PEN": "0",
  4528. "SRC_POL": "0",
  4529. "SRC_WIDTH": "00000000000000000000000000000001",
  4530. "TYPE": "$setup",
  4531. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4532. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4533. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4534. "T_LIMIT_MAX": "00000000000000000000000111110111",
  4535. "T_LIMIT_MIN": "00000000000000000000000111110111",
  4536. "T_LIMIT_TYP": "00000000000000000000000111110111"
  4537. },
  4538. "attributes": {
  4539. "module_not_derived": "00000000000000000000000000000001",
  4540. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1709.3-1709.36"
  4541. },
  4542. "port_directions": {
  4543. "DST": "input",
  4544. "DST_EN": "output",
  4545. "SRC": "input",
  4546. "SRC_EN": "output"
  4547. },
  4548. "connections": {
  4549. "DST": [ 18 ],
  4550. "DST_EN": [ "1" ],
  4551. "SRC": [ 19 ],
  4552. "SRC_EN": [ "1" ]
  4553. }
  4554. },
  4555. "$specify$2644": {
  4556. "hide_name": 1,
  4557. "type": "$specrule",
  4558. "parameters": {
  4559. "DST_PEN": "1",
  4560. "DST_POL": "1",
  4561. "DST_WIDTH": "00000000000000000000000000000001",
  4562. "SRC_PEN": "0",
  4563. "SRC_POL": "0",
  4564. "SRC_WIDTH": "00000000000000000000000000000001",
  4565. "TYPE": "$setup",
  4566. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4567. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4568. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4569. "T_LIMIT_MAX": "00000000000000000000000010111001",
  4570. "T_LIMIT_MIN": "00000000000000000000000010111001",
  4571. "T_LIMIT_TYP": "00000000000000000000000010111001"
  4572. },
  4573. "attributes": {
  4574. "module_not_derived": "00000000000000000000000000000001",
  4575. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1711.3-1711.33"
  4576. },
  4577. "port_directions": {
  4578. "DST": "input",
  4579. "DST_EN": "output",
  4580. "SRC": "input",
  4581. "SRC_EN": "output"
  4582. },
  4583. "connections": {
  4584. "DST": [ 18 ],
  4585. "DST_EN": [ "1" ],
  4586. "SRC": [ 20 ],
  4587. "SRC_EN": [ "1" ]
  4588. }
  4589. },
  4590. "$specify$2645": {
  4591. "hide_name": 1,
  4592. "type": "$specrule",
  4593. "parameters": {
  4594. "DST_PEN": "1",
  4595. "DST_POL": "1",
  4596. "DST_WIDTH": "00000000000000000000000000000001",
  4597. "SRC_PEN": "0",
  4598. "SRC_POL": "0",
  4599. "SRC_WIDTH": "00000000000000000000000000001011",
  4600. "TYPE": "$setup",
  4601. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4602. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4603. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4604. "T_LIMIT_MAX": "00000000000000000000000110101000",
  4605. "T_LIMIT_MIN": "00000000000000000000000110101000",
  4606. "T_LIMIT_TYP": "00000000000000000000000110101000"
  4607. },
  4608. "attributes": {
  4609. "module_not_derived": "00000000000000000000000000000001",
  4610. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.3-1713.52"
  4611. },
  4612. "port_directions": {
  4613. "DST": "input",
  4614. "DST_EN": "output",
  4615. "SRC": "input",
  4616. "SRC_EN": "output"
  4617. },
  4618. "connections": {
  4619. "DST": [ 32 ],
  4620. "DST_EN": [ 80 ],
  4621. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  4622. "SRC_EN": [ "1" ]
  4623. }
  4624. },
  4625. "$specify$2646": {
  4626. "hide_name": 1,
  4627. "type": "$specrule",
  4628. "parameters": {
  4629. "DST_PEN": "1",
  4630. "DST_POL": "1",
  4631. "DST_WIDTH": "00000000000000000000000000000001",
  4632. "SRC_PEN": "0",
  4633. "SRC_POL": "0",
  4634. "SRC_WIDTH": "00000000000000000000000000000001",
  4635. "TYPE": "$setup",
  4636. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4637. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4638. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4639. "T_LIMIT_MAX": "00000000000000000000000111110111",
  4640. "T_LIMIT_MIN": "00000000000000000000000111110111",
  4641. "T_LIMIT_TYP": "00000000000000000000000111110111"
  4642. },
  4643. "attributes": {
  4644. "module_not_derived": "00000000000000000000000000000001",
  4645. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1715.3-1715.36"
  4646. },
  4647. "port_directions": {
  4648. "DST": "input",
  4649. "DST_EN": "output",
  4650. "SRC": "input",
  4651. "SRC_EN": "output"
  4652. },
  4653. "connections": {
  4654. "DST": [ 32 ],
  4655. "DST_EN": [ "1" ],
  4656. "SRC": [ 33 ],
  4657. "SRC_EN": [ "1" ]
  4658. }
  4659. },
  4660. "$specify$2647": {
  4661. "hide_name": 1,
  4662. "type": "$specrule",
  4663. "parameters": {
  4664. "DST_PEN": "1",
  4665. "DST_POL": "1",
  4666. "DST_WIDTH": "00000000000000000000000000000001",
  4667. "SRC_PEN": "0",
  4668. "SRC_POL": "0",
  4669. "SRC_WIDTH": "00000000000000000000000000010000",
  4670. "TYPE": "$setup",
  4671. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4672. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4673. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4674. "T_LIMIT_MAX": "00000000000000000000000100110001",
  4675. "T_LIMIT_MIN": "00000000000000000000000100110001",
  4676. "T_LIMIT_TYP": "00000000000000000000000100110001"
  4677. },
  4678. "attributes": {
  4679. "module_not_derived": "00000000000000000000000000000001",
  4680. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.3-1717.52"
  4681. },
  4682. "port_directions": {
  4683. "DST": "input",
  4684. "DST_EN": "output",
  4685. "SRC": "input",
  4686. "SRC_EN": "output"
  4687. },
  4688. "connections": {
  4689. "DST": [ 32 ],
  4690. "DST_EN": [ 81 ],
  4691. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  4692. "SRC_EN": [ "1" ]
  4693. }
  4694. },
  4695. "$specify$2648": {
  4696. "hide_name": 1,
  4697. "type": "$specrule",
  4698. "parameters": {
  4699. "DST_PEN": "1",
  4700. "DST_POL": "1",
  4701. "DST_WIDTH": "00000000000000000000000000000001",
  4702. "SRC_PEN": "0",
  4703. "SRC_POL": "0",
  4704. "SRC_WIDTH": "00000000000000000000000000000001",
  4705. "TYPE": "$setup",
  4706. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  4707. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  4708. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  4709. "T_LIMIT_MAX": "00000000000000000000000011111100",
  4710. "T_LIMIT_MIN": "00000000000000000000000011111100",
  4711. "T_LIMIT_TYP": "00000000000000000000000011111100"
  4712. },
  4713. "attributes": {
  4714. "module_not_derived": "00000000000000000000000000000001",
  4715. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1719.3-1719.33"
  4716. },
  4717. "port_directions": {
  4718. "DST": "input",
  4719. "DST_EN": "output",
  4720. "SRC": "input",
  4721. "SRC_EN": "output"
  4722. },
  4723. "connections": {
  4724. "DST": [ 32 ],
  4725. "DST_EN": [ "1" ],
  4726. "SRC": [ 34 ],
  4727. "SRC_EN": [ "1" ]
  4728. }
  4729. },
  4730. "$specify$2649": {
  4731. "hide_name": 1,
  4732. "type": "$specify3",
  4733. "parameters": {
  4734. "DAT_DST_PEN": "0",
  4735. "DAT_DST_POL": "0",
  4736. "DST_WIDTH": "00000000000000000000000000010000",
  4737. "EDGE_EN": "1",
  4738. "EDGE_POL": "1",
  4739. "FULL": "1",
  4740. "SRC_DST_PEN": "0",
  4741. "SRC_DST_POL": "0",
  4742. "SRC_WIDTH": "00000000000000000000000000000001",
  4743. "T_FALL_MAX": "00000000000000000000010010011011",
  4744. "T_FALL_MIN": "00000000000000000000010010011011",
  4745. "T_FALL_TYP": "00000000000000000000010010011011",
  4746. "T_RISE_MAX": "00000000000000000000010010011011",
  4747. "T_RISE_MIN": "00000000000000000000010010011011",
  4748. "T_RISE_TYP": "00000000000000000000010010011011"
  4749. },
  4750. "attributes": {
  4751. "module_not_derived": "00000000000000000000000000000001",
  4752. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1721.3-1721.44"
  4753. },
  4754. "port_directions": {
  4755. "DAT": "input",
  4756. "DST": "input",
  4757. "EN": "input",
  4758. "SRC": "input"
  4759. },
  4760. "connections": {
  4761. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  4762. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  4763. "EN": [ "1" ],
  4764. "SRC": [ 18 ]
  4765. }
  4766. }
  4767. },
  4768. "netnames": {
  4769. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$43674_Y": {
  4770. "hide_name": 1,
  4771. "bits": [ 78 ],
  4772. "attributes": {
  4773. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  4774. }
  4775. },
  4776. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$43675_Y": {
  4777. "hide_name": 1,
  4778. "bits": [ 79 ],
  4779. "attributes": {
  4780. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  4781. }
  4782. },
  4783. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$43676_Y": {
  4784. "hide_name": 1,
  4785. "bits": [ 80 ],
  4786. "attributes": {
  4787. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  4788. }
  4789. },
  4790. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$43677_Y": {
  4791. "hide_name": 1,
  4792. "bits": [ 81 ],
  4793. "attributes": {
  4794. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  4795. }
  4796. },
  4797. "MASK": {
  4798. "hide_name": 0,
  4799. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  4800. "attributes": {
  4801. "defaultvalue": "0000000000000000",
  4802. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  4803. }
  4804. },
  4805. "RADDR": {
  4806. "hide_name": 0,
  4807. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  4808. "attributes": {
  4809. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1492.16-1492.21"
  4810. }
  4811. },
  4812. "RCLK": {
  4813. "hide_name": 0,
  4814. "bits": [ 18 ],
  4815. "attributes": {
  4816. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1489.16-1489.20"
  4817. }
  4818. },
  4819. "RCLKE": {
  4820. "hide_name": 0,
  4821. "bits": [ 19 ],
  4822. "attributes": {
  4823. "defaultvalue": "1",
  4824. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1490.16-1490.21"
  4825. }
  4826. },
  4827. "RDATA": {
  4828. "hide_name": 0,
  4829. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  4830. "attributes": {
  4831. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21"
  4832. }
  4833. },
  4834. "RE": {
  4835. "hide_name": 0,
  4836. "bits": [ 20 ],
  4837. "attributes": {
  4838. "defaultvalue": "0",
  4839. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1491.16-1491.18"
  4840. }
  4841. },
  4842. "WADDR": {
  4843. "hide_name": 0,
  4844. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  4845. "attributes": {
  4846. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1496.16-1496.21"
  4847. }
  4848. },
  4849. "WCLK": {
  4850. "hide_name": 0,
  4851. "bits": [ 32 ],
  4852. "attributes": {
  4853. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1493.16-1493.20"
  4854. }
  4855. },
  4856. "WCLKE": {
  4857. "hide_name": 0,
  4858. "bits": [ 33 ],
  4859. "attributes": {
  4860. "defaultvalue": "1",
  4861. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  4862. }
  4863. },
  4864. "WDATA": {
  4865. "hide_name": 0,
  4866. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  4867. "attributes": {
  4868. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1498.16-1498.21"
  4869. }
  4870. },
  4871. "WE": {
  4872. "hide_name": 0,
  4873. "bits": [ 34 ],
  4874. "attributes": {
  4875. "defaultvalue": "0",
  4876. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1495.16-1495.18"
  4877. }
  4878. }
  4879. }
  4880. },
  4881. "$paramod\\SB_LUT4\\LUT_INIT=16'1000000000000000": {
  4882. "attributes": {
  4883. "blackbox": "00000000000000000000000000000001",
  4884. "hdlname": "SB_LUT4",
  4885. "abc9_lut": "00000000000000000000000000000001",
  4886. "cells_not_processed": "00000000000000000000000000000001",
  4887. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:177.1-225.10"
  4888. },
  4889. "parameter_default_values": {
  4890. "LUT_INIT": "1000000000000000"
  4891. },
  4892. "ports": {
  4893. "O": {
  4894. "direction": "output",
  4895. "bits": [ 2 ]
  4896. },
  4897. "I0": {
  4898. "direction": "input",
  4899. "bits": [ 3 ]
  4900. },
  4901. "I1": {
  4902. "direction": "input",
  4903. "bits": [ 4 ]
  4904. },
  4905. "I2": {
  4906. "direction": "input",
  4907. "bits": [ 5 ]
  4908. },
  4909. "I3": {
  4910. "direction": "input",
  4911. "bits": [ 6 ]
  4912. }
  4913. },
  4914. "cells": {
  4915. },
  4916. "netnames": {
  4917. "I0": {
  4918. "hide_name": 0,
  4919. "bits": [ 3 ],
  4920. "attributes": {
  4921. "defaultvalue": "0",
  4922. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:179.8-179.10"
  4923. }
  4924. },
  4925. "I1": {
  4926. "hide_name": 0,
  4927. "bits": [ 4 ],
  4928. "attributes": {
  4929. "defaultvalue": "0",
  4930. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:180.8-180.10"
  4931. }
  4932. },
  4933. "I2": {
  4934. "hide_name": 0,
  4935. "bits": [ 5 ],
  4936. "attributes": {
  4937. "defaultvalue": "0",
  4938. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:181.8-181.10"
  4939. }
  4940. },
  4941. "I3": {
  4942. "hide_name": 0,
  4943. "bits": [ 6 ],
  4944. "attributes": {
  4945. "defaultvalue": "0",
  4946. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:182.8-182.10"
  4947. }
  4948. },
  4949. "O": {
  4950. "hide_name": 0,
  4951. "bits": [ 2 ],
  4952. "attributes": {
  4953. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:178.9-178.10"
  4954. }
  4955. }
  4956. }
  4957. },
  4958. "$paramod\\SB_LUT4\\LUT_INIT=16'1001000000001001": {
  4959. "attributes": {
  4960. "blackbox": "00000000000000000000000000000001",
  4961. "hdlname": "SB_LUT4",
  4962. "abc9_lut": "00000000000000000000000000000001",
  4963. "cells_not_processed": "00000000000000000000000000000001",
  4964. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:177.1-225.10"
  4965. },
  4966. "parameter_default_values": {
  4967. "LUT_INIT": "1001000000001001"
  4968. },
  4969. "ports": {
  4970. "O": {
  4971. "direction": "output",
  4972. "bits": [ 2 ]
  4973. },
  4974. "I0": {
  4975. "direction": "input",
  4976. "bits": [ 3 ]
  4977. },
  4978. "I1": {
  4979. "direction": "input",
  4980. "bits": [ 4 ]
  4981. },
  4982. "I2": {
  4983. "direction": "input",
  4984. "bits": [ 5 ]
  4985. },
  4986. "I3": {
  4987. "direction": "input",
  4988. "bits": [ 6 ]
  4989. }
  4990. },
  4991. "cells": {
  4992. },
  4993. "netnames": {
  4994. "I0": {
  4995. "hide_name": 0,
  4996. "bits": [ 3 ],
  4997. "attributes": {
  4998. "defaultvalue": "0",
  4999. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:179.8-179.10"
  5000. }
  5001. },
  5002. "I1": {
  5003. "hide_name": 0,
  5004. "bits": [ 4 ],
  5005. "attributes": {
  5006. "defaultvalue": "0",
  5007. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:180.8-180.10"
  5008. }
  5009. },
  5010. "I2": {
  5011. "hide_name": 0,
  5012. "bits": [ 5 ],
  5013. "attributes": {
  5014. "defaultvalue": "0",
  5015. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:181.8-181.10"
  5016. }
  5017. },
  5018. "I3": {
  5019. "hide_name": 0,
  5020. "bits": [ 6 ],
  5021. "attributes": {
  5022. "defaultvalue": "0",
  5023. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:182.8-182.10"
  5024. }
  5025. },
  5026. "O": {
  5027. "hide_name": 0,
  5028. "bits": [ 2 ],
  5029. "attributes": {
  5030. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:178.9-178.10"
  5031. }
  5032. }
  5033. }
  5034. },
  5035. "$paramod\\SB_LUT4\\LUT_INIT=s32'00000000000000000000010000000000": {
  5036. "attributes": {
  5037. "blackbox": "00000000000000000000000000000001",
  5038. "hdlname": "SB_LUT4",
  5039. "abc9_lut": "00000000000000000000000000000001",
  5040. "cells_not_processed": "00000000000000000000000000000001",
  5041. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:177.1-225.10"
  5042. },
  5043. "parameter_default_values": {
  5044. "LUT_INIT": "0000010000000000"
  5045. },
  5046. "ports": {
  5047. "O": {
  5048. "direction": "output",
  5049. "bits": [ 2 ]
  5050. },
  5051. "I0": {
  5052. "direction": "input",
  5053. "bits": [ 3 ]
  5054. },
  5055. "I1": {
  5056. "direction": "input",
  5057. "bits": [ 4 ]
  5058. },
  5059. "I2": {
  5060. "direction": "input",
  5061. "bits": [ 5 ]
  5062. },
  5063. "I3": {
  5064. "direction": "input",
  5065. "bits": [ 6 ]
  5066. }
  5067. },
  5068. "cells": {
  5069. },
  5070. "netnames": {
  5071. "I0": {
  5072. "hide_name": 0,
  5073. "bits": [ 3 ],
  5074. "attributes": {
  5075. "defaultvalue": "0",
  5076. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:179.8-179.10"
  5077. }
  5078. },
  5079. "I1": {
  5080. "hide_name": 0,
  5081. "bits": [ 4 ],
  5082. "attributes": {
  5083. "defaultvalue": "0",
  5084. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:180.8-180.10"
  5085. }
  5086. },
  5087. "I2": {
  5088. "hide_name": 0,
  5089. "bits": [ 5 ],
  5090. "attributes": {
  5091. "defaultvalue": "0",
  5092. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:181.8-181.10"
  5093. }
  5094. },
  5095. "I3": {
  5096. "hide_name": 0,
  5097. "bits": [ 6 ],
  5098. "attributes": {
  5099. "defaultvalue": "0",
  5100. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:182.8-182.10"
  5101. }
  5102. },
  5103. "O": {
  5104. "hide_name": 0,
  5105. "bits": [ 2 ],
  5106. "attributes": {
  5107. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:178.9-178.10"
  5108. }
  5109. }
  5110. }
  5111. },
  5112. "ICESTORM_LC": {
  5113. "attributes": {
  5114. "blackbox": "00000000000000000000000000000001",
  5115. "cells_not_processed": "00000000000000000000000000000001",
  5116. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2136.1-2420.10"
  5117. },
  5118. "parameter_default_values": {
  5119. "ASYNC_SR": "0",
  5120. "CARRY_ENABLE": "0",
  5121. "CIN_CONST": "0",
  5122. "CIN_SET": "0",
  5123. "DFF_ENABLE": "0",
  5124. "LUT_INIT": "0000000000000000",
  5125. "NEG_CLK": "0",
  5126. "SET_NORESET": "0"
  5127. },
  5128. "ports": {
  5129. "I0": {
  5130. "direction": "input",
  5131. "bits": [ 2 ]
  5132. },
  5133. "I1": {
  5134. "direction": "input",
  5135. "bits": [ 3 ]
  5136. },
  5137. "I2": {
  5138. "direction": "input",
  5139. "bits": [ 4 ]
  5140. },
  5141. "I3": {
  5142. "direction": "input",
  5143. "bits": [ 5 ]
  5144. },
  5145. "CIN": {
  5146. "direction": "input",
  5147. "bits": [ 6 ]
  5148. },
  5149. "CLK": {
  5150. "direction": "input",
  5151. "bits": [ 7 ]
  5152. },
  5153. "CEN": {
  5154. "direction": "input",
  5155. "bits": [ 8 ]
  5156. },
  5157. "SR": {
  5158. "direction": "input",
  5159. "bits": [ 9 ]
  5160. },
  5161. "LO": {
  5162. "direction": "output",
  5163. "bits": [ 10 ]
  5164. },
  5165. "O": {
  5166. "direction": "output",
  5167. "bits": [ 11 ]
  5168. },
  5169. "COUT": {
  5170. "direction": "output",
  5171. "bits": [ 12 ]
  5172. }
  5173. },
  5174. "cells": {
  5175. "$specify$2677": {
  5176. "hide_name": 1,
  5177. "type": "$specify2",
  5178. "parameters": {
  5179. "DST_WIDTH": "00000000000000000000000000000001",
  5180. "FULL": "0",
  5181. "SRC_DST_PEN": "0",
  5182. "SRC_DST_POL": "0",
  5183. "SRC_WIDTH": "00000000000000000000000000000001",
  5184. "T_FALL_MAX": "00000000000000000000000100010110",
  5185. "T_FALL_MIN": "00000000000000000000000001100111",
  5186. "T_FALL_TYP": "00000000000000000000000010110101",
  5187. "T_RISE_MAX": "00000000000000000000000100010110",
  5188. "T_RISE_MIN": "00000000000000000000000001100111",
  5189. "T_RISE_TYP": "00000000000000000000000010110101"
  5190. },
  5191. "attributes": {
  5192. "module_not_derived": "00000000000000000000000000000001",
  5193. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2359.2-2359.45"
  5194. },
  5195. "port_directions": {
  5196. "DST": "input",
  5197. "EN": "input",
  5198. "SRC": "input"
  5199. },
  5200. "connections": {
  5201. "DST": [ 12 ],
  5202. "EN": [ "1" ],
  5203. "SRC": [ 6 ]
  5204. }
  5205. },
  5206. "$specify$2678": {
  5207. "hide_name": 1,
  5208. "type": "$specify2",
  5209. "parameters": {
  5210. "DST_WIDTH": "00000000000000000000000000000001",
  5211. "FULL": "0",
  5212. "SRC_DST_PEN": "0",
  5213. "SRC_DST_POL": "0",
  5214. "SRC_WIDTH": "00000000000000000000000000000001",
  5215. "T_FALL_MAX": "00000000000000000000010100000101",
  5216. "T_FALL_MIN": "00000000000000000000000111011101",
  5217. "T_FALL_TYP": "00000000000000000000001101000010",
  5218. "T_RISE_MAX": "00000000000000000000010011100111",
  5219. "T_RISE_MIN": "00000000000000000000000111001110",
  5220. "T_RISE_TYP": "00000000000000000000001100101000"
  5221. },
  5222. "attributes": {
  5223. "module_not_derived": "00000000000000000000000000000001",
  5224. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2361.2-2361.43"
  5225. },
  5226. "port_directions": {
  5227. "DST": "input",
  5228. "EN": "input",
  5229. "SRC": "input"
  5230. },
  5231. "connections": {
  5232. "DST": [ 11 ],
  5233. "EN": [ "1" ],
  5234. "SRC": [ 2 ]
  5235. }
  5236. },
  5237. "$specify$2679": {
  5238. "hide_name": 1,
  5239. "type": "$specify2",
  5240. "parameters": {
  5241. "DST_WIDTH": "00000000000000000000000000000001",
  5242. "FULL": "0",
  5243. "SRC_DST_PEN": "0",
  5244. "SRC_DST_POL": "0",
  5245. "SRC_WIDTH": "00000000000000000000000000000001",
  5246. "T_FALL_MAX": "00000000000000000000001110000101",
  5247. "T_FALL_MIN": "00000000000000000000000101001110",
  5248. "T_FALL_TYP": "00000000000000000000001001001001",
  5249. "T_RISE_MAX": "00000000000000000000001101010000",
  5250. "T_RISE_MIN": "00000000000000000000000100111011",
  5251. "T_RISE_TYP": "00000000000000000000001000100110"
  5252. },
  5253. "attributes": {
  5254. "module_not_derived": "00000000000000000000000000000001",
  5255. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2363.2-2363.42"
  5256. },
  5257. "port_directions": {
  5258. "DST": "input",
  5259. "EN": "input",
  5260. "SRC": "input"
  5261. },
  5262. "connections": {
  5263. "DST": [ 10 ],
  5264. "EN": [ "1" ],
  5265. "SRC": [ 2 ]
  5266. }
  5267. },
  5268. "$specify$2680": {
  5269. "hide_name": 1,
  5270. "type": "$specify2",
  5271. "parameters": {
  5272. "DST_WIDTH": "00000000000000000000000000000001",
  5273. "FULL": "0",
  5274. "SRC_DST_PEN": "0",
  5275. "SRC_DST_POL": "0",
  5276. "SRC_WIDTH": "00000000000000000000000000000001",
  5277. "T_FALL_MAX": "00000000000000000000001010010110",
  5278. "T_FALL_MIN": "00000000000000000000000011110110",
  5279. "T_FALL_TYP": "00000000000000000000000110101110",
  5280. "T_RISE_MAX": "00000000000000000000001010100011",
  5281. "T_RISE_MIN": "00000000000000000000000011111011",
  5282. "T_RISE_TYP": "00000000000000000000000110110110"
  5283. },
  5284. "attributes": {
  5285. "module_not_derived": "00000000000000000000000000000001",
  5286. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2365.2-2365.44"
  5287. },
  5288. "port_directions": {
  5289. "DST": "input",
  5290. "EN": "input",
  5291. "SRC": "input"
  5292. },
  5293. "connections": {
  5294. "DST": [ 12 ],
  5295. "EN": [ "1" ],
  5296. "SRC": [ 3 ]
  5297. }
  5298. },
  5299. "$specify$2681": {
  5300. "hide_name": 1,
  5301. "type": "$specify2",
  5302. "parameters": {
  5303. "DST_WIDTH": "00000000000000000000000000000001",
  5304. "FULL": "0",
  5305. "SRC_DST_PEN": "0",
  5306. "SRC_DST_POL": "0",
  5307. "SRC_WIDTH": "00000000000000000000000000000001",
  5308. "T_FALL_MAX": "00000000000000000000010011010000",
  5309. "T_FALL_MIN": "00000000000000000000000111001001",
  5310. "T_FALL_TYP": "00000000000000000000001100011111",
  5311. "T_RISE_MAX": "00000000000000000000010010011011",
  5312. "T_RISE_MIN": "00000000000000000000000110110110",
  5313. "T_RISE_TYP": "00000000000000000000001011111101"
  5314. },
  5315. "attributes": {
  5316. "module_not_derived": "00000000000000000000000000000001",
  5317. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2367.2-2367.43"
  5318. },
  5319. "port_directions": {
  5320. "DST": "input",
  5321. "EN": "input",
  5322. "SRC": "input"
  5323. },
  5324. "connections": {
  5325. "DST": [ 11 ],
  5326. "EN": [ "1" ],
  5327. "SRC": [ 3 ]
  5328. }
  5329. },
  5330. "$specify$2682": {
  5331. "hide_name": 1,
  5332. "type": "$specify2",
  5333. "parameters": {
  5334. "DST_WIDTH": "00000000000000000000000000000001",
  5335. "FULL": "0",
  5336. "SRC_DST_PEN": "0",
  5337. "SRC_DST_POL": "0",
  5338. "SRC_WIDTH": "00000000000000000000000000000001",
  5339. "T_FALL_MAX": "00000000000000000000001101110111",
  5340. "T_FALL_MIN": "00000000000000000000000101001001",
  5341. "T_FALL_TYP": "00000000000000000000001001000000",
  5342. "T_RISE_MAX": "00000000000000000000001011100110",
  5343. "T_RISE_MIN": "00000000000000000000000100010011",
  5344. "T_RISE_TYP": "00000000000000000000000111100001"
  5345. },
  5346. "attributes": {
  5347. "module_not_derived": "00000000000000000000000000000001",
  5348. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2369.2-2369.42"
  5349. },
  5350. "port_directions": {
  5351. "DST": "input",
  5352. "EN": "input",
  5353. "SRC": "input"
  5354. },
  5355. "connections": {
  5356. "DST": [ 10 ],
  5357. "EN": [ "1" ],
  5358. "SRC": [ 3 ]
  5359. }
  5360. },
  5361. "$specify$2683": {
  5362. "hide_name": 1,
  5363. "type": "$specify2",
  5364. "parameters": {
  5365. "DST_WIDTH": "00000000000000000000000000000001",
  5366. "FULL": "0",
  5367. "SRC_DST_PEN": "0",
  5368. "SRC_DST_POL": "0",
  5369. "SRC_WIDTH": "00000000000000000000000000000001",
  5370. "T_FALL_MAX": "00000000000000000000000101100110",
  5371. "T_FALL_MIN": "00000000000000000000000010000101",
  5372. "T_FALL_TYP": "00000000000000000000000011101000",
  5373. "T_RISE_MAX": "00000000000000000000001001100001",
  5374. "T_RISE_MIN": "00000000000000000000000011100010",
  5375. "T_RISE_TYP": "00000000000000000000000110001011"
  5376. },
  5377. "attributes": {
  5378. "module_not_derived": "00000000000000000000000000000001",
  5379. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2371.2-2371.44"
  5380. },
  5381. "port_directions": {
  5382. "DST": "input",
  5383. "EN": "input",
  5384. "SRC": "input"
  5385. },
  5386. "connections": {
  5387. "DST": [ 12 ],
  5388. "EN": [ "1" ],
  5389. "SRC": [ 4 ]
  5390. }
  5391. },
  5392. "$specify$2684": {
  5393. "hide_name": 1,
  5394. "type": "$specify2",
  5395. "parameters": {
  5396. "DST_WIDTH": "00000000000000000000000000000001",
  5397. "FULL": "0",
  5398. "SRC_DST_PEN": "0",
  5399. "SRC_DST_POL": "0",
  5400. "SRC_WIDTH": "00000000000000000000000000000001",
  5401. "T_FALL_MAX": "00000000000000000000010010110101",
  5402. "T_FALL_MIN": "00000000000000000000000110111111",
  5403. "T_FALL_TYP": "00000000000000000000001100001110",
  5404. "T_RISE_MAX": "00000000000000000000010010011011",
  5405. "T_RISE_MIN": "00000000000000000000000110110110",
  5406. "T_RISE_TYP": "00000000000000000000001011111101"
  5407. },
  5408. "attributes": {
  5409. "module_not_derived": "00000000000000000000000000000001",
  5410. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2373.2-2373.43"
  5411. },
  5412. "port_directions": {
  5413. "DST": "input",
  5414. "EN": "input",
  5415. "SRC": "input"
  5416. },
  5417. "connections": {
  5418. "DST": [ 11 ],
  5419. "EN": [ "1" ],
  5420. "SRC": [ 4 ]
  5421. }
  5422. },
  5423. "$specify$2685": {
  5424. "hide_name": 1,
  5425. "type": "$specify2",
  5426. "parameters": {
  5427. "DST_WIDTH": "00000000000000000000000000000001",
  5428. "FULL": "0",
  5429. "SRC_DST_PEN": "0",
  5430. "SRC_DST_POL": "0",
  5431. "SRC_WIDTH": "00000000000000000000000000000001",
  5432. "T_FALL_MAX": "00000000000000000000001100001101",
  5433. "T_FALL_MIN": "00000000000000000000000100100010",
  5434. "T_FALL_TYP": "00000000000000000000000111111011",
  5435. "T_RISE_MAX": "00000000000000000000001010111110",
  5436. "T_RISE_MIN": "00000000000000000000000100000101",
  5437. "T_RISE_TYP": "00000000000000000000000111001000"
  5438. },
  5439. "attributes": {
  5440. "module_not_derived": "00000000000000000000000000000001",
  5441. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2375.2-2375.42"
  5442. },
  5443. "port_directions": {
  5444. "DST": "input",
  5445. "EN": "input",
  5446. "SRC": "input"
  5447. },
  5448. "connections": {
  5449. "DST": [ 10 ],
  5450. "EN": [ "1" ],
  5451. "SRC": [ 4 ]
  5452. }
  5453. },
  5454. "$specify$2686": {
  5455. "hide_name": 1,
  5456. "type": "$specify2",
  5457. "parameters": {
  5458. "DST_WIDTH": "00000000000000000000000000000001",
  5459. "FULL": "0",
  5460. "SRC_DST_PEN": "0",
  5461. "SRC_DST_POL": "0",
  5462. "SRC_WIDTH": "00000000000000000000000000000001",
  5463. "T_FALL_MAX": "00000000000000000000001101101010",
  5464. "T_FALL_MIN": "00000000000000000000000011100010",
  5465. "T_FALL_TYP": "00000000000000000000000101110010",
  5466. "T_RISE_MAX": "00000000000000000000001101011101",
  5467. "T_RISE_MIN": "00000000000000000000000101000000",
  5468. "T_RISE_TYP": "00000000000000000000001000101111"
  5469. },
  5470. "attributes": {
  5471. "module_not_derived": "00000000000000000000000000000001",
  5472. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2377.2-2377.41"
  5473. },
  5474. "port_directions": {
  5475. "DST": "input",
  5476. "EN": "input",
  5477. "SRC": "input"
  5478. },
  5479. "connections": {
  5480. "DST": [ 11 ],
  5481. "EN": [ "1" ],
  5482. "SRC": [ 5 ]
  5483. }
  5484. },
  5485. "$specify$2687": {
  5486. "hide_name": 1,
  5487. "type": "$specify2",
  5488. "parameters": {
  5489. "DST_WIDTH": "00000000000000000000000000000001",
  5490. "FULL": "0",
  5491. "SRC_DST_PEN": "0",
  5492. "SRC_DST_POL": "0",
  5493. "SRC_WIDTH": "00000000000000000000000000000001",
  5494. "T_FALL_MAX": "00000000000000000000001001100001",
  5495. "T_FALL_MIN": "00000000000000000000000011100010",
  5496. "T_FALL_TYP": "00000000000000000000000110001011",
  5497. "T_RISE_MAX": "00000000000000000000001001000111",
  5498. "T_RISE_MIN": "00000000000000000000000011011000",
  5499. "T_RISE_TYP": "00000000000000000000000101111010"
  5500. },
  5501. "attributes": {
  5502. "module_not_derived": "00000000000000000000000000000001",
  5503. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2379.2-2379.42"
  5504. },
  5505. "port_directions": {
  5506. "DST": "input",
  5507. "EN": "input",
  5508. "SRC": "input"
  5509. },
  5510. "connections": {
  5511. "DST": [ 10 ],
  5512. "EN": [ "1" ],
  5513. "SRC": [ 5 ]
  5514. }
  5515. },
  5516. "$specify$2688": {
  5517. "hide_name": 1,
  5518. "type": "$specify3",
  5519. "parameters": {
  5520. "DAT_DST_PEN": "0",
  5521. "DAT_DST_POL": "0",
  5522. "DST_WIDTH": "00000000000000000000000000000001",
  5523. "EDGE_EN": "1",
  5524. "EDGE_POL": "1",
  5525. "FULL": "0",
  5526. "SRC_DST_PEN": "0",
  5527. "SRC_DST_POL": "0",
  5528. "SRC_WIDTH": "00000000000000000000000000000001",
  5529. "T_FALL_MAX": "00000000000000000000010101101111",
  5530. "T_FALL_MIN": "00000000000000000000001000000100",
  5531. "T_FALL_TYP": "00000000000000000000001110000111",
  5532. "T_RISE_MAX": "00000000000000000000010101101111",
  5533. "T_RISE_MIN": "00000000000000000000001000000100",
  5534. "T_RISE_TYP": "00000000000000000000001110000111"
  5535. },
  5536. "attributes": {
  5537. "module_not_derived": "00000000000000000000000000000001",
  5538. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2381.2-2381.61"
  5539. },
  5540. "port_directions": {
  5541. "DAT": "input",
  5542. "DST": "input",
  5543. "EN": "input",
  5544. "SRC": "input"
  5545. },
  5546. "connections": {
  5547. "DAT": [ "x" ],
  5548. "DST": [ 11 ],
  5549. "EN": [ "1" ],
  5550. "SRC": [ 7 ]
  5551. }
  5552. },
  5553. "$specify$2689": {
  5554. "hide_name": 1,
  5555. "type": "$specify2",
  5556. "parameters": {
  5557. "DST_WIDTH": "00000000000000000000000000000001",
  5558. "FULL": "0",
  5559. "SRC_DST_PEN": "0",
  5560. "SRC_DST_POL": "0",
  5561. "SRC_WIDTH": "00000000000000000000000000000001",
  5562. "T_FALL_MAX": "00000000000000000000011000110101",
  5563. "T_FALL_MIN": "00000000000000000000001001001110",
  5564. "T_FALL_TYP": "00000000000000000000010000001000",
  5565. "T_RISE_MAX": "00000000000000000000010001101011",
  5566. "T_RISE_MIN": "00000000000000000000000110100100",
  5567. "T_RISE_TYP": "00000000000000000000001011011110"
  5568. },
  5569. "attributes": {
  5570. "module_not_derived": "00000000000000000000000000000001",
  5571. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2383.2-2383.44"
  5572. },
  5573. "port_directions": {
  5574. "DST": "input",
  5575. "EN": "input",
  5576. "SRC": "input"
  5577. },
  5578. "connections": {
  5579. "DST": [ 11 ],
  5580. "EN": [ "1" ],
  5581. "SRC": [ 9 ]
  5582. }
  5583. },
  5584. "$specify$2690": {
  5585. "hide_name": 1,
  5586. "type": "$specrule",
  5587. "parameters": {
  5588. "DST_PEN": "1",
  5589. "DST_POL": "1",
  5590. "DST_WIDTH": "00000000000000000000000000000001",
  5591. "SRC_PEN": "1",
  5592. "SRC_POL": "1",
  5593. "SRC_WIDTH": "00000000000000000000000000000001",
  5594. "TYPE": "$setuphold",
  5595. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5596. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5597. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5598. "T_LIMIT_MAX": "00000000000000000000010011010000",
  5599. "T_LIMIT_MIN": "00000000000000000000000111001001",
  5600. "T_LIMIT_TYP": "00000000000000000000001100011111"
  5601. },
  5602. "attributes": {
  5603. "module_not_derived": "00000000000000000000000000000001",
  5604. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2385.2-2385.59"
  5605. },
  5606. "port_directions": {
  5607. "DST": "input",
  5608. "DST_EN": "output",
  5609. "SRC": "input",
  5610. "SRC_EN": "output"
  5611. },
  5612. "connections": {
  5613. "DST": [ 2 ],
  5614. "DST_EN": [ "1" ],
  5615. "SRC": [ 7 ],
  5616. "SRC_EN": [ "1" ]
  5617. }
  5618. },
  5619. "$specify$2691": {
  5620. "hide_name": 1,
  5621. "type": "$specrule",
  5622. "parameters": {
  5623. "DST_PEN": "1",
  5624. "DST_POL": "0",
  5625. "DST_WIDTH": "00000000000000000000000000000001",
  5626. "SRC_PEN": "1",
  5627. "SRC_POL": "1",
  5628. "SRC_WIDTH": "00000000000000000000000000000001",
  5629. "TYPE": "$setuphold",
  5630. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5631. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5632. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5633. "T_LIMIT_MAX": "00000000000000000000010000100100",
  5634. "T_LIMIT_MIN": "00000000000000000000000110001001",
  5635. "T_LIMIT_TYP": "00000000000000000000001010110000"
  5636. },
  5637. "attributes": {
  5638. "module_not_derived": "00000000000000000000000000000001",
  5639. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2387.2-2387.59"
  5640. },
  5641. "port_directions": {
  5642. "DST": "input",
  5643. "DST_EN": "output",
  5644. "SRC": "input",
  5645. "SRC_EN": "output"
  5646. },
  5647. "connections": {
  5648. "DST": [ 2 ],
  5649. "DST_EN": [ "1" ],
  5650. "SRC": [ 7 ],
  5651. "SRC_EN": [ "1" ]
  5652. }
  5653. },
  5654. "$specify$2692": {
  5655. "hide_name": 1,
  5656. "type": "$specrule",
  5657. "parameters": {
  5658. "DST_PEN": "1",
  5659. "DST_POL": "1",
  5660. "DST_WIDTH": "00000000000000000000000000000001",
  5661. "SRC_PEN": "1",
  5662. "SRC_POL": "0",
  5663. "SRC_WIDTH": "00000000000000000000000000000001",
  5664. "TYPE": "$setuphold",
  5665. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5666. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5667. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5668. "T_LIMIT_MAX": "00000000000000000000010011010000",
  5669. "T_LIMIT_MIN": "00000000000000000000000111001001",
  5670. "T_LIMIT_TYP": "00000000000000000000001100011111"
  5671. },
  5672. "attributes": {
  5673. "module_not_derived": "00000000000000000000000000000001",
  5674. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2388.2-2388.59"
  5675. },
  5676. "port_directions": {
  5677. "DST": "input",
  5678. "DST_EN": "output",
  5679. "SRC": "input",
  5680. "SRC_EN": "output"
  5681. },
  5682. "connections": {
  5683. "DST": [ 2 ],
  5684. "DST_EN": [ "1" ],
  5685. "SRC": [ 7 ],
  5686. "SRC_EN": [ "1" ]
  5687. }
  5688. },
  5689. "$specify$2693": {
  5690. "hide_name": 1,
  5691. "type": "$specrule",
  5692. "parameters": {
  5693. "DST_PEN": "1",
  5694. "DST_POL": "0",
  5695. "DST_WIDTH": "00000000000000000000000000000001",
  5696. "SRC_PEN": "1",
  5697. "SRC_POL": "0",
  5698. "SRC_WIDTH": "00000000000000000000000000000001",
  5699. "TYPE": "$setuphold",
  5700. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5701. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5702. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5703. "T_LIMIT_MAX": "00000000000000000000010000100100",
  5704. "T_LIMIT_MIN": "00000000000000000000000110001001",
  5705. "T_LIMIT_TYP": "00000000000000000000001010110000"
  5706. },
  5707. "attributes": {
  5708. "module_not_derived": "00000000000000000000000000000001",
  5709. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2389.2-2389.59"
  5710. },
  5711. "port_directions": {
  5712. "DST": "input",
  5713. "DST_EN": "output",
  5714. "SRC": "input",
  5715. "SRC_EN": "output"
  5716. },
  5717. "connections": {
  5718. "DST": [ 2 ],
  5719. "DST_EN": [ "1" ],
  5720. "SRC": [ 7 ],
  5721. "SRC_EN": [ "1" ]
  5722. }
  5723. },
  5724. "$specify$2694": {
  5725. "hide_name": 1,
  5726. "type": "$specrule",
  5727. "parameters": {
  5728. "DST_PEN": "1",
  5729. "DST_POL": "1",
  5730. "DST_WIDTH": "00000000000000000000000000000001",
  5731. "SRC_PEN": "1",
  5732. "SRC_POL": "1",
  5733. "SRC_WIDTH": "00000000000000000000000000000001",
  5734. "TYPE": "$setuphold",
  5735. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5736. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5737. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5738. "T_LIMIT_MAX": "00000000000000000000010000100100",
  5739. "T_LIMIT_MIN": "00000000000000000000000110001001",
  5740. "T_LIMIT_TYP": "00000000000000000000001010110000"
  5741. },
  5742. "attributes": {
  5743. "module_not_derived": "00000000000000000000000000000001",
  5744. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2391.2-2391.59"
  5745. },
  5746. "port_directions": {
  5747. "DST": "input",
  5748. "DST_EN": "output",
  5749. "SRC": "input",
  5750. "SRC_EN": "output"
  5751. },
  5752. "connections": {
  5753. "DST": [ 3 ],
  5754. "DST_EN": [ "1" ],
  5755. "SRC": [ 7 ],
  5756. "SRC_EN": [ "1" ]
  5757. }
  5758. },
  5759. "$specify$2695": {
  5760. "hide_name": 1,
  5761. "type": "$specrule",
  5762. "parameters": {
  5763. "DST_PEN": "1",
  5764. "DST_POL": "0",
  5765. "DST_WIDTH": "00000000000000000000000000000001",
  5766. "SRC_PEN": "1",
  5767. "SRC_POL": "1",
  5768. "SRC_WIDTH": "00000000000000000000000000000001",
  5769. "TYPE": "$setuphold",
  5770. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5771. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5772. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5773. "T_LIMIT_MAX": "00000000000000000000001111101111",
  5774. "T_LIMIT_MIN": "00000000000000000000000101110101",
  5775. "T_LIMIT_TYP": "00000000000000000000001010001101"
  5776. },
  5777. "attributes": {
  5778. "module_not_derived": "00000000000000000000000000000001",
  5779. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2393.2-2393.59"
  5780. },
  5781. "port_directions": {
  5782. "DST": "input",
  5783. "DST_EN": "output",
  5784. "SRC": "input",
  5785. "SRC_EN": "output"
  5786. },
  5787. "connections": {
  5788. "DST": [ 3 ],
  5789. "DST_EN": [ "1" ],
  5790. "SRC": [ 7 ],
  5791. "SRC_EN": [ "1" ]
  5792. }
  5793. },
  5794. "$specify$2696": {
  5795. "hide_name": 1,
  5796. "type": "$specrule",
  5797. "parameters": {
  5798. "DST_PEN": "1",
  5799. "DST_POL": "1",
  5800. "DST_WIDTH": "00000000000000000000000000000001",
  5801. "SRC_PEN": "1",
  5802. "SRC_POL": "0",
  5803. "SRC_WIDTH": "00000000000000000000000000000001",
  5804. "TYPE": "$setuphold",
  5805. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5806. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5807. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5808. "T_LIMIT_MAX": "00000000000000000000010000100100",
  5809. "T_LIMIT_MIN": "00000000000000000000000110001001",
  5810. "T_LIMIT_TYP": "00000000000000000000001010110000"
  5811. },
  5812. "attributes": {
  5813. "module_not_derived": "00000000000000000000000000000001",
  5814. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2394.2-2394.59"
  5815. },
  5816. "port_directions": {
  5817. "DST": "input",
  5818. "DST_EN": "output",
  5819. "SRC": "input",
  5820. "SRC_EN": "output"
  5821. },
  5822. "connections": {
  5823. "DST": [ 3 ],
  5824. "DST_EN": [ "1" ],
  5825. "SRC": [ 7 ],
  5826. "SRC_EN": [ "1" ]
  5827. }
  5828. },
  5829. "$specify$2697": {
  5830. "hide_name": 1,
  5831. "type": "$specrule",
  5832. "parameters": {
  5833. "DST_PEN": "1",
  5834. "DST_POL": "0",
  5835. "DST_WIDTH": "00000000000000000000000000000001",
  5836. "SRC_PEN": "1",
  5837. "SRC_POL": "0",
  5838. "SRC_WIDTH": "00000000000000000000000000000001",
  5839. "TYPE": "$setuphold",
  5840. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5841. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5842. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5843. "T_LIMIT_MAX": "00000000000000000000001111101111",
  5844. "T_LIMIT_MIN": "00000000000000000000000101110101",
  5845. "T_LIMIT_TYP": "00000000000000000000001010001101"
  5846. },
  5847. "attributes": {
  5848. "module_not_derived": "00000000000000000000000000000001",
  5849. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2395.2-2395.59"
  5850. },
  5851. "port_directions": {
  5852. "DST": "input",
  5853. "DST_EN": "output",
  5854. "SRC": "input",
  5855. "SRC_EN": "output"
  5856. },
  5857. "connections": {
  5858. "DST": [ 3 ],
  5859. "DST_EN": [ "1" ],
  5860. "SRC": [ 7 ],
  5861. "SRC_EN": [ "1" ]
  5862. }
  5863. },
  5864. "$specify$2698": {
  5865. "hide_name": 1,
  5866. "type": "$specrule",
  5867. "parameters": {
  5868. "DST_PEN": "1",
  5869. "DST_POL": "1",
  5870. "DST_WIDTH": "00000000000000000000000000000001",
  5871. "SRC_PEN": "1",
  5872. "SRC_POL": "1",
  5873. "SRC_WIDTH": "00000000000000000000000000000001",
  5874. "TYPE": "$setuphold",
  5875. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5876. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5877. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5878. "T_LIMIT_MAX": "00000000000000000000001111010100",
  5879. "T_LIMIT_MIN": "00000000000000000000000101101100",
  5880. "T_LIMIT_TYP": "00000000000000000000001001111100"
  5881. },
  5882. "attributes": {
  5883. "module_not_derived": "00000000000000000000000000000001",
  5884. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2397.2-2397.58"
  5885. },
  5886. "port_directions": {
  5887. "DST": "input",
  5888. "DST_EN": "output",
  5889. "SRC": "input",
  5890. "SRC_EN": "output"
  5891. },
  5892. "connections": {
  5893. "DST": [ 4 ],
  5894. "DST_EN": [ "1" ],
  5895. "SRC": [ 7 ],
  5896. "SRC_EN": [ "1" ]
  5897. }
  5898. },
  5899. "$specify$2699": {
  5900. "hide_name": 1,
  5901. "type": "$specrule",
  5902. "parameters": {
  5903. "DST_PEN": "1",
  5904. "DST_POL": "0",
  5905. "DST_WIDTH": "00000000000000000000000000000001",
  5906. "SRC_PEN": "1",
  5907. "SRC_POL": "1",
  5908. "SRC_WIDTH": "00000000000000000000000000000001",
  5909. "TYPE": "$setuphold",
  5910. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5911. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5912. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5913. "T_LIMIT_MAX": "00000000000000000000001101011101",
  5914. "T_LIMIT_MIN": "00000000000000000000000101000000",
  5915. "T_LIMIT_TYP": "00000000000000000000001000101111"
  5916. },
  5917. "attributes": {
  5918. "module_not_derived": "00000000000000000000000000000001",
  5919. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2399.2-2399.58"
  5920. },
  5921. "port_directions": {
  5922. "DST": "input",
  5923. "DST_EN": "output",
  5924. "SRC": "input",
  5925. "SRC_EN": "output"
  5926. },
  5927. "connections": {
  5928. "DST": [ 4 ],
  5929. "DST_EN": [ "1" ],
  5930. "SRC": [ 7 ],
  5931. "SRC_EN": [ "1" ]
  5932. }
  5933. },
  5934. "$specify$2700": {
  5935. "hide_name": 1,
  5936. "type": "$specrule",
  5937. "parameters": {
  5938. "DST_PEN": "1",
  5939. "DST_POL": "1",
  5940. "DST_WIDTH": "00000000000000000000000000000001",
  5941. "SRC_PEN": "1",
  5942. "SRC_POL": "0",
  5943. "SRC_WIDTH": "00000000000000000000000000000001",
  5944. "TYPE": "$setuphold",
  5945. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5946. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5947. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5948. "T_LIMIT_MAX": "00000000000000000000001111010100",
  5949. "T_LIMIT_MIN": "00000000000000000000000101101100",
  5950. "T_LIMIT_TYP": "00000000000000000000001001111100"
  5951. },
  5952. "attributes": {
  5953. "module_not_derived": "00000000000000000000000000000001",
  5954. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2400.2-2400.58"
  5955. },
  5956. "port_directions": {
  5957. "DST": "input",
  5958. "DST_EN": "output",
  5959. "SRC": "input",
  5960. "SRC_EN": "output"
  5961. },
  5962. "connections": {
  5963. "DST": [ 4 ],
  5964. "DST_EN": [ "1" ],
  5965. "SRC": [ 7 ],
  5966. "SRC_EN": [ "1" ]
  5967. }
  5968. },
  5969. "$specify$2701": {
  5970. "hide_name": 1,
  5971. "type": "$specrule",
  5972. "parameters": {
  5973. "DST_PEN": "1",
  5974. "DST_POL": "0",
  5975. "DST_WIDTH": "00000000000000000000000000000001",
  5976. "SRC_PEN": "1",
  5977. "SRC_POL": "0",
  5978. "SRC_WIDTH": "00000000000000000000000000000001",
  5979. "TYPE": "$setuphold",
  5980. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  5981. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  5982. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  5983. "T_LIMIT_MAX": "00000000000000000000001101011101",
  5984. "T_LIMIT_MIN": "00000000000000000000000101000000",
  5985. "T_LIMIT_TYP": "00000000000000000000001000101111"
  5986. },
  5987. "attributes": {
  5988. "module_not_derived": "00000000000000000000000000000001",
  5989. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2401.2-2401.58"
  5990. },
  5991. "port_directions": {
  5992. "DST": "input",
  5993. "DST_EN": "output",
  5994. "SRC": "input",
  5995. "SRC_EN": "output"
  5996. },
  5997. "connections": {
  5998. "DST": [ 4 ],
  5999. "DST_EN": [ "1" ],
  6000. "SRC": [ 7 ],
  6001. "SRC_EN": [ "1" ]
  6002. }
  6003. },
  6004. "$specify$2702": {
  6005. "hide_name": 1,
  6006. "type": "$specrule",
  6007. "parameters": {
  6008. "DST_PEN": "1",
  6009. "DST_POL": "1",
  6010. "DST_WIDTH": "00000000000000000000000000000001",
  6011. "SRC_PEN": "1",
  6012. "SRC_POL": "1",
  6013. "SRC_WIDTH": "00000000000000000000000000000001",
  6014. "TYPE": "$setuphold",
  6015. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6016. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6017. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6018. "T_LIMIT_MAX": "00000000000000000000001011011000",
  6019. "T_LIMIT_MIN": "00000000000000000000000100010111",
  6020. "T_LIMIT_TYP": "00000000000000000000000111011001"
  6021. },
  6022. "attributes": {
  6023. "module_not_derived": "00000000000000000000000000000001",
  6024. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2403.2-2403.58"
  6025. },
  6026. "port_directions": {
  6027. "DST": "input",
  6028. "DST_EN": "output",
  6029. "SRC": "input",
  6030. "SRC_EN": "output"
  6031. },
  6032. "connections": {
  6033. "DST": [ 5 ],
  6034. "DST_EN": [ "1" ],
  6035. "SRC": [ 7 ],
  6036. "SRC_EN": [ "1" ]
  6037. }
  6038. },
  6039. "$specify$2703": {
  6040. "hide_name": 1,
  6041. "type": "$specrule",
  6042. "parameters": {
  6043. "DST_PEN": "1",
  6044. "DST_POL": "0",
  6045. "DST_WIDTH": "00000000000000000000000000000001",
  6046. "SRC_PEN": "1",
  6047. "SRC_POL": "1",
  6048. "SRC_WIDTH": "00000000000000000000000000000001",
  6049. "TYPE": "$setuphold",
  6050. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6051. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6052. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6053. "T_LIMIT_MAX": "00000000000000000000001001000111",
  6054. "T_LIMIT_MIN": "00000000000000000000000011011000",
  6055. "T_LIMIT_TYP": "00000000000000000000000101111010"
  6056. },
  6057. "attributes": {
  6058. "module_not_derived": "00000000000000000000000000000001",
  6059. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2405.2-2405.58"
  6060. },
  6061. "port_directions": {
  6062. "DST": "input",
  6063. "DST_EN": "output",
  6064. "SRC": "input",
  6065. "SRC_EN": "output"
  6066. },
  6067. "connections": {
  6068. "DST": [ 5 ],
  6069. "DST_EN": [ "1" ],
  6070. "SRC": [ 7 ],
  6071. "SRC_EN": [ "1" ]
  6072. }
  6073. },
  6074. "$specify$2704": {
  6075. "hide_name": 1,
  6076. "type": "$specrule",
  6077. "parameters": {
  6078. "DST_PEN": "1",
  6079. "DST_POL": "1",
  6080. "DST_WIDTH": "00000000000000000000000000000001",
  6081. "SRC_PEN": "1",
  6082. "SRC_POL": "0",
  6083. "SRC_WIDTH": "00000000000000000000000000000001",
  6084. "TYPE": "$setuphold",
  6085. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6086. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6087. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6088. "T_LIMIT_MAX": "00000000000000000000001011011000",
  6089. "T_LIMIT_MIN": "00000000000000000000000100010111",
  6090. "T_LIMIT_TYP": "00000000000000000000000111011001"
  6091. },
  6092. "attributes": {
  6093. "module_not_derived": "00000000000000000000000000000001",
  6094. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2406.2-2406.58"
  6095. },
  6096. "port_directions": {
  6097. "DST": "input",
  6098. "DST_EN": "output",
  6099. "SRC": "input",
  6100. "SRC_EN": "output"
  6101. },
  6102. "connections": {
  6103. "DST": [ 5 ],
  6104. "DST_EN": [ "1" ],
  6105. "SRC": [ 7 ],
  6106. "SRC_EN": [ "1" ]
  6107. }
  6108. },
  6109. "$specify$2705": {
  6110. "hide_name": 1,
  6111. "type": "$specrule",
  6112. "parameters": {
  6113. "DST_PEN": "1",
  6114. "DST_POL": "0",
  6115. "DST_WIDTH": "00000000000000000000000000000001",
  6116. "SRC_PEN": "1",
  6117. "SRC_POL": "0",
  6118. "SRC_WIDTH": "00000000000000000000000000000001",
  6119. "TYPE": "$setuphold",
  6120. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6121. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6122. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6123. "T_LIMIT_MAX": "00000000000000000000001001000111",
  6124. "T_LIMIT_MIN": "00000000000000000000000011011000",
  6125. "T_LIMIT_TYP": "00000000000000000000000101111010"
  6126. },
  6127. "attributes": {
  6128. "module_not_derived": "00000000000000000000000000000001",
  6129. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2407.2-2407.58"
  6130. },
  6131. "port_directions": {
  6132. "DST": "input",
  6133. "DST_EN": "output",
  6134. "SRC": "input",
  6135. "SRC_EN": "output"
  6136. },
  6137. "connections": {
  6138. "DST": [ 5 ],
  6139. "DST_EN": [ "1" ],
  6140. "SRC": [ 7 ],
  6141. "SRC_EN": [ "1" ]
  6142. }
  6143. },
  6144. "$specify$2706": {
  6145. "hide_name": 1,
  6146. "type": "$specrule",
  6147. "parameters": {
  6148. "DST_PEN": "1",
  6149. "DST_POL": "0",
  6150. "DST_WIDTH": "00000000000000000000000000000001",
  6151. "SRC_PEN": "1",
  6152. "SRC_POL": "1",
  6153. "SRC_WIDTH": "00000000000000000000000000000001",
  6154. "TYPE": "$setuphold",
  6155. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6156. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6157. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6158. "T_LIMIT_MAX": "00000000000000000000000000000000",
  6159. "T_LIMIT_MIN": "00000000000000000000000000000000",
  6160. "T_LIMIT_TYP": "00000000000000000000000000000000"
  6161. },
  6162. "attributes": {
  6163. "module_not_derived": "00000000000000000000000000000001",
  6164. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2409.2-2409.53"
  6165. },
  6166. "port_directions": {
  6167. "DST": "input",
  6168. "DST_EN": "output",
  6169. "SRC": "input",
  6170. "SRC_EN": "output"
  6171. },
  6172. "connections": {
  6173. "DST": [ 8 ],
  6174. "DST_EN": [ "1" ],
  6175. "SRC": [ 7 ],
  6176. "SRC_EN": [ "1" ]
  6177. }
  6178. },
  6179. "$specify$2707": {
  6180. "hide_name": 1,
  6181. "type": "$specrule",
  6182. "parameters": {
  6183. "DST_PEN": "1",
  6184. "DST_POL": "1",
  6185. "DST_WIDTH": "00000000000000000000000000000001",
  6186. "SRC_PEN": "1",
  6187. "SRC_POL": "1",
  6188. "SRC_WIDTH": "00000000000000000000000000000001",
  6189. "TYPE": "$setuphold",
  6190. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6191. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6192. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6193. "T_LIMIT_MAX": "00000000000000000000000000000000",
  6194. "T_LIMIT_MIN": "00000000000000000000000000000000",
  6195. "T_LIMIT_TYP": "00000000000000000000000000000000"
  6196. },
  6197. "attributes": {
  6198. "module_not_derived": "00000000000000000000000000000001",
  6199. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2411.2-2411.53"
  6200. },
  6201. "port_directions": {
  6202. "DST": "input",
  6203. "DST_EN": "output",
  6204. "SRC": "input",
  6205. "SRC_EN": "output"
  6206. },
  6207. "connections": {
  6208. "DST": [ 8 ],
  6209. "DST_EN": [ "1" ],
  6210. "SRC": [ 7 ],
  6211. "SRC_EN": [ "1" ]
  6212. }
  6213. },
  6214. "$specify$2708": {
  6215. "hide_name": 1,
  6216. "type": "$specrule",
  6217. "parameters": {
  6218. "DST_PEN": "1",
  6219. "DST_POL": "1",
  6220. "DST_WIDTH": "00000000000000000000000000000001",
  6221. "SRC_PEN": "1",
  6222. "SRC_POL": "1",
  6223. "SRC_WIDTH": "00000000000000000000000000000001",
  6224. "TYPE": "$setuphold",
  6225. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6226. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6227. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6228. "T_LIMIT_MAX": "00000000000000000000001000010010",
  6229. "T_LIMIT_MIN": "00000000000000000000000011000101",
  6230. "T_LIMIT_TYP": "00000000000000000000000101011000"
  6231. },
  6232. "attributes": {
  6233. "module_not_derived": "00000000000000000000000000000001",
  6234. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2413.2-2413.58"
  6235. },
  6236. "port_directions": {
  6237. "DST": "input",
  6238. "DST_EN": "output",
  6239. "SRC": "input",
  6240. "SRC_EN": "output"
  6241. },
  6242. "connections": {
  6243. "DST": [ 9 ],
  6244. "DST_EN": [ "1" ],
  6245. "SRC": [ 7 ],
  6246. "SRC_EN": [ "1" ]
  6247. }
  6248. },
  6249. "$specify$2709": {
  6250. "hide_name": 1,
  6251. "type": "$specrule",
  6252. "parameters": {
  6253. "DST_PEN": "1",
  6254. "DST_POL": "0",
  6255. "DST_WIDTH": "00000000000000000000000000000001",
  6256. "SRC_PEN": "1",
  6257. "SRC_POL": "1",
  6258. "SRC_WIDTH": "00000000000000000000000000000001",
  6259. "TYPE": "$setuphold",
  6260. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6261. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6262. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6263. "T_LIMIT_MAX": "00000000000000000000000110000000",
  6264. "T_LIMIT_MIN": "00000000000000000000000010001111",
  6265. "T_LIMIT_TYP": "00000000000000000000000011111001"
  6266. },
  6267. "attributes": {
  6268. "module_not_derived": "00000000000000000000000000000001",
  6269. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2415.2-2415.58"
  6270. },
  6271. "port_directions": {
  6272. "DST": "input",
  6273. "DST_EN": "output",
  6274. "SRC": "input",
  6275. "SRC_EN": "output"
  6276. },
  6277. "connections": {
  6278. "DST": [ 9 ],
  6279. "DST_EN": [ "1" ],
  6280. "SRC": [ 7 ],
  6281. "SRC_EN": [ "1" ]
  6282. }
  6283. },
  6284. "$specify$2710": {
  6285. "hide_name": 1,
  6286. "type": "$specrule",
  6287. "parameters": {
  6288. "DST_PEN": "1",
  6289. "DST_POL": "1",
  6290. "DST_WIDTH": "00000000000000000000000000000001",
  6291. "SRC_PEN": "1",
  6292. "SRC_POL": "0",
  6293. "SRC_WIDTH": "00000000000000000000000000000001",
  6294. "TYPE": "$setuphold",
  6295. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6296. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6297. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6298. "T_LIMIT_MAX": "00000000000000000000001000010010",
  6299. "T_LIMIT_MIN": "00000000000000000000000011000101",
  6300. "T_LIMIT_TYP": "00000000000000000000000101011000"
  6301. },
  6302. "attributes": {
  6303. "module_not_derived": "00000000000000000000000000000001",
  6304. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2416.2-2416.58"
  6305. },
  6306. "port_directions": {
  6307. "DST": "input",
  6308. "DST_EN": "output",
  6309. "SRC": "input",
  6310. "SRC_EN": "output"
  6311. },
  6312. "connections": {
  6313. "DST": [ 9 ],
  6314. "DST_EN": [ "1" ],
  6315. "SRC": [ 7 ],
  6316. "SRC_EN": [ "1" ]
  6317. }
  6318. },
  6319. "$specify$2711": {
  6320. "hide_name": 1,
  6321. "type": "$specrule",
  6322. "parameters": {
  6323. "DST_PEN": "1",
  6324. "DST_POL": "0",
  6325. "DST_WIDTH": "00000000000000000000000000000001",
  6326. "SRC_PEN": "1",
  6327. "SRC_POL": "0",
  6328. "SRC_WIDTH": "00000000000000000000000000000001",
  6329. "TYPE": "$setuphold",
  6330. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  6331. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  6332. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  6333. "T_LIMIT_MAX": "00000000000000000000000011001111",
  6334. "T_LIMIT_MIN": "00000000000000000000000010000011",
  6335. "T_LIMIT_TYP": "00000000000000000000000010101010"
  6336. },
  6337. "attributes": {
  6338. "module_not_derived": "00000000000000000000000000000001",
  6339. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2417.2-2417.58"
  6340. },
  6341. "port_directions": {
  6342. "DST": "input",
  6343. "DST_EN": "output",
  6344. "SRC": "input",
  6345. "SRC_EN": "output"
  6346. },
  6347. "connections": {
  6348. "DST": [ 9 ],
  6349. "DST_EN": [ "1" ],
  6350. "SRC": [ 7 ],
  6351. "SRC_EN": [ "1" ]
  6352. }
  6353. }
  6354. },
  6355. "netnames": {
  6356. "CEN": {
  6357. "hide_name": 0,
  6358. "bits": [ 8 ],
  6359. "attributes": {
  6360. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.34-2137.37"
  6361. }
  6362. },
  6363. "CIN": {
  6364. "hide_name": 0,
  6365. "bits": [ 6 ],
  6366. "attributes": {
  6367. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.24-2137.27"
  6368. }
  6369. },
  6370. "CLK": {
  6371. "hide_name": 0,
  6372. "bits": [ 7 ],
  6373. "attributes": {
  6374. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.29-2137.32"
  6375. }
  6376. },
  6377. "COUT": {
  6378. "hide_name": 0,
  6379. "bits": [ 12 ],
  6380. "attributes": {
  6381. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2140.9-2140.13"
  6382. }
  6383. },
  6384. "I0": {
  6385. "hide_name": 0,
  6386. "bits": [ 2 ],
  6387. "attributes": {
  6388. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.8-2137.10"
  6389. }
  6390. },
  6391. "I1": {
  6392. "hide_name": 0,
  6393. "bits": [ 3 ],
  6394. "attributes": {
  6395. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.12-2137.14"
  6396. }
  6397. },
  6398. "I2": {
  6399. "hide_name": 0,
  6400. "bits": [ 4 ],
  6401. "attributes": {
  6402. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.16-2137.18"
  6403. }
  6404. },
  6405. "I3": {
  6406. "hide_name": 0,
  6407. "bits": [ 5 ],
  6408. "attributes": {
  6409. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.20-2137.22"
  6410. }
  6411. },
  6412. "LO": {
  6413. "hide_name": 0,
  6414. "bits": [ 10 ],
  6415. "attributes": {
  6416. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2138.9-2138.11"
  6417. }
  6418. },
  6419. "O": {
  6420. "hide_name": 0,
  6421. "bits": [ 11 ],
  6422. "attributes": {
  6423. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2139.9-2139.10"
  6424. }
  6425. },
  6426. "SR": {
  6427. "hide_name": 0,
  6428. "bits": [ 9 ],
  6429. "attributes": {
  6430. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2137.39-2137.41"
  6431. }
  6432. }
  6433. }
  6434. },
  6435. "ICESTORM_RAM": {
  6436. "attributes": {
  6437. "blackbox": "00000000000000000000000000000001",
  6438. "cells_not_processed": "00000000000000000000000000000001",
  6439. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3167.1-3502.10"
  6440. },
  6441. "parameter_default_values": {
  6442. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6443. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6444. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6445. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6446. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6447. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6448. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6449. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6450. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6451. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6452. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6453. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6454. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6455. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6456. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6457. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  6458. "NEG_CLK_R": "0",
  6459. "NEG_CLK_W": "0",
  6460. "READ_MODE": "00000000000000000000000000000000",
  6461. "WRITE_MODE": "00000000000000000000000000000000"
  6462. },
  6463. "ports": {
  6464. "RDATA_15": {
  6465. "direction": "output",
  6466. "bits": [ 2 ]
  6467. },
  6468. "RDATA_14": {
  6469. "direction": "output",
  6470. "bits": [ 3 ]
  6471. },
  6472. "RDATA_13": {
  6473. "direction": "output",
  6474. "bits": [ 4 ]
  6475. },
  6476. "RDATA_12": {
  6477. "direction": "output",
  6478. "bits": [ 5 ]
  6479. },
  6480. "RDATA_11": {
  6481. "direction": "output",
  6482. "bits": [ 6 ]
  6483. },
  6484. "RDATA_10": {
  6485. "direction": "output",
  6486. "bits": [ 7 ]
  6487. },
  6488. "RDATA_9": {
  6489. "direction": "output",
  6490. "bits": [ 8 ]
  6491. },
  6492. "RDATA_8": {
  6493. "direction": "output",
  6494. "bits": [ 9 ]
  6495. },
  6496. "RDATA_7": {
  6497. "direction": "output",
  6498. "bits": [ 10 ]
  6499. },
  6500. "RDATA_6": {
  6501. "direction": "output",
  6502. "bits": [ 11 ]
  6503. },
  6504. "RDATA_5": {
  6505. "direction": "output",
  6506. "bits": [ 12 ]
  6507. },
  6508. "RDATA_4": {
  6509. "direction": "output",
  6510. "bits": [ 13 ]
  6511. },
  6512. "RDATA_3": {
  6513. "direction": "output",
  6514. "bits": [ 14 ]
  6515. },
  6516. "RDATA_2": {
  6517. "direction": "output",
  6518. "bits": [ 15 ]
  6519. },
  6520. "RDATA_1": {
  6521. "direction": "output",
  6522. "bits": [ 16 ]
  6523. },
  6524. "RDATA_0": {
  6525. "direction": "output",
  6526. "bits": [ 17 ]
  6527. },
  6528. "RCLK": {
  6529. "direction": "input",
  6530. "bits": [ 18 ]
  6531. },
  6532. "RCLKE": {
  6533. "direction": "input",
  6534. "bits": [ 19 ]
  6535. },
  6536. "RE": {
  6537. "direction": "input",
  6538. "bits": [ 20 ]
  6539. },
  6540. "RADDR_10": {
  6541. "direction": "input",
  6542. "bits": [ 21 ]
  6543. },
  6544. "RADDR_9": {
  6545. "direction": "input",
  6546. "bits": [ 22 ]
  6547. },
  6548. "RADDR_8": {
  6549. "direction": "input",
  6550. "bits": [ 23 ]
  6551. },
  6552. "RADDR_7": {
  6553. "direction": "input",
  6554. "bits": [ 24 ]
  6555. },
  6556. "RADDR_6": {
  6557. "direction": "input",
  6558. "bits": [ 25 ]
  6559. },
  6560. "RADDR_5": {
  6561. "direction": "input",
  6562. "bits": [ 26 ]
  6563. },
  6564. "RADDR_4": {
  6565. "direction": "input",
  6566. "bits": [ 27 ]
  6567. },
  6568. "RADDR_3": {
  6569. "direction": "input",
  6570. "bits": [ 28 ]
  6571. },
  6572. "RADDR_2": {
  6573. "direction": "input",
  6574. "bits": [ 29 ]
  6575. },
  6576. "RADDR_1": {
  6577. "direction": "input",
  6578. "bits": [ 30 ]
  6579. },
  6580. "RADDR_0": {
  6581. "direction": "input",
  6582. "bits": [ 31 ]
  6583. },
  6584. "WCLK": {
  6585. "direction": "input",
  6586. "bits": [ 32 ]
  6587. },
  6588. "WCLKE": {
  6589. "direction": "input",
  6590. "bits": [ 33 ]
  6591. },
  6592. "WE": {
  6593. "direction": "input",
  6594. "bits": [ 34 ]
  6595. },
  6596. "WADDR_10": {
  6597. "direction": "input",
  6598. "bits": [ 35 ]
  6599. },
  6600. "WADDR_9": {
  6601. "direction": "input",
  6602. "bits": [ 36 ]
  6603. },
  6604. "WADDR_8": {
  6605. "direction": "input",
  6606. "bits": [ 37 ]
  6607. },
  6608. "WADDR_7": {
  6609. "direction": "input",
  6610. "bits": [ 38 ]
  6611. },
  6612. "WADDR_6": {
  6613. "direction": "input",
  6614. "bits": [ 39 ]
  6615. },
  6616. "WADDR_5": {
  6617. "direction": "input",
  6618. "bits": [ 40 ]
  6619. },
  6620. "WADDR_4": {
  6621. "direction": "input",
  6622. "bits": [ 41 ]
  6623. },
  6624. "WADDR_3": {
  6625. "direction": "input",
  6626. "bits": [ 42 ]
  6627. },
  6628. "WADDR_2": {
  6629. "direction": "input",
  6630. "bits": [ 43 ]
  6631. },
  6632. "WADDR_1": {
  6633. "direction": "input",
  6634. "bits": [ 44 ]
  6635. },
  6636. "WADDR_0": {
  6637. "direction": "input",
  6638. "bits": [ 45 ]
  6639. },
  6640. "MASK_15": {
  6641. "direction": "input",
  6642. "bits": [ 46 ]
  6643. },
  6644. "MASK_14": {
  6645. "direction": "input",
  6646. "bits": [ 47 ]
  6647. },
  6648. "MASK_13": {
  6649. "direction": "input",
  6650. "bits": [ 48 ]
  6651. },
  6652. "MASK_12": {
  6653. "direction": "input",
  6654. "bits": [ 49 ]
  6655. },
  6656. "MASK_11": {
  6657. "direction": "input",
  6658. "bits": [ 50 ]
  6659. },
  6660. "MASK_10": {
  6661. "direction": "input",
  6662. "bits": [ 51 ]
  6663. },
  6664. "MASK_9": {
  6665. "direction": "input",
  6666. "bits": [ 52 ]
  6667. },
  6668. "MASK_8": {
  6669. "direction": "input",
  6670. "bits": [ 53 ]
  6671. },
  6672. "MASK_7": {
  6673. "direction": "input",
  6674. "bits": [ 54 ]
  6675. },
  6676. "MASK_6": {
  6677. "direction": "input",
  6678. "bits": [ 55 ]
  6679. },
  6680. "MASK_5": {
  6681. "direction": "input",
  6682. "bits": [ 56 ]
  6683. },
  6684. "MASK_4": {
  6685. "direction": "input",
  6686. "bits": [ 57 ]
  6687. },
  6688. "MASK_3": {
  6689. "direction": "input",
  6690. "bits": [ 58 ]
  6691. },
  6692. "MASK_2": {
  6693. "direction": "input",
  6694. "bits": [ 59 ]
  6695. },
  6696. "MASK_1": {
  6697. "direction": "input",
  6698. "bits": [ 60 ]
  6699. },
  6700. "MASK_0": {
  6701. "direction": "input",
  6702. "bits": [ 61 ]
  6703. },
  6704. "WDATA_15": {
  6705. "direction": "input",
  6706. "bits": [ 62 ]
  6707. },
  6708. "WDATA_14": {
  6709. "direction": "input",
  6710. "bits": [ 63 ]
  6711. },
  6712. "WDATA_13": {
  6713. "direction": "input",
  6714. "bits": [ 64 ]
  6715. },
  6716. "WDATA_12": {
  6717. "direction": "input",
  6718. "bits": [ 65 ]
  6719. },
  6720. "WDATA_11": {
  6721. "direction": "input",
  6722. "bits": [ 66 ]
  6723. },
  6724. "WDATA_10": {
  6725. "direction": "input",
  6726. "bits": [ 67 ]
  6727. },
  6728. "WDATA_9": {
  6729. "direction": "input",
  6730. "bits": [ 68 ]
  6731. },
  6732. "WDATA_8": {
  6733. "direction": "input",
  6734. "bits": [ 69 ]
  6735. },
  6736. "WDATA_7": {
  6737. "direction": "input",
  6738. "bits": [ 70 ]
  6739. },
  6740. "WDATA_6": {
  6741. "direction": "input",
  6742. "bits": [ 71 ]
  6743. },
  6744. "WDATA_5": {
  6745. "direction": "input",
  6746. "bits": [ 72 ]
  6747. },
  6748. "WDATA_4": {
  6749. "direction": "input",
  6750. "bits": [ 73 ]
  6751. },
  6752. "WDATA_3": {
  6753. "direction": "input",
  6754. "bits": [ 74 ]
  6755. },
  6756. "WDATA_2": {
  6757. "direction": "input",
  6758. "bits": [ 75 ]
  6759. },
  6760. "WDATA_1": {
  6761. "direction": "input",
  6762. "bits": [ 76 ]
  6763. },
  6764. "WDATA_0": {
  6765. "direction": "input",
  6766. "bits": [ 77 ]
  6767. }
  6768. },
  6769. "cells": {
  6770. },
  6771. "netnames": {
  6772. "MASK_0": {
  6773. "hide_name": 0,
  6774. "bits": [ 61 ],
  6775. "attributes": {
  6776. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.135-3173.141"
  6777. }
  6778. },
  6779. "MASK_1": {
  6780. "hide_name": 0,
  6781. "bits": [ 60 ],
  6782. "attributes": {
  6783. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.127-3173.133"
  6784. }
  6785. },
  6786. "MASK_10": {
  6787. "hide_name": 0,
  6788. "bits": [ 51 ],
  6789. "attributes": {
  6790. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.54-3173.61"
  6791. }
  6792. },
  6793. "MASK_11": {
  6794. "hide_name": 0,
  6795. "bits": [ 50 ],
  6796. "attributes": {
  6797. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.45-3173.52"
  6798. }
  6799. },
  6800. "MASK_12": {
  6801. "hide_name": 0,
  6802. "bits": [ 49 ],
  6803. "attributes": {
  6804. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.36-3173.43"
  6805. }
  6806. },
  6807. "MASK_13": {
  6808. "hide_name": 0,
  6809. "bits": [ 48 ],
  6810. "attributes": {
  6811. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.27-3173.34"
  6812. }
  6813. },
  6814. "MASK_14": {
  6815. "hide_name": 0,
  6816. "bits": [ 47 ],
  6817. "attributes": {
  6818. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.18-3173.25"
  6819. }
  6820. },
  6821. "MASK_15": {
  6822. "hide_name": 0,
  6823. "bits": [ 46 ],
  6824. "attributes": {
  6825. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.9-3173.16"
  6826. }
  6827. },
  6828. "MASK_2": {
  6829. "hide_name": 0,
  6830. "bits": [ 59 ],
  6831. "attributes": {
  6832. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.119-3173.125"
  6833. }
  6834. },
  6835. "MASK_3": {
  6836. "hide_name": 0,
  6837. "bits": [ 58 ],
  6838. "attributes": {
  6839. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.111-3173.117"
  6840. }
  6841. },
  6842. "MASK_4": {
  6843. "hide_name": 0,
  6844. "bits": [ 57 ],
  6845. "attributes": {
  6846. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.103-3173.109"
  6847. }
  6848. },
  6849. "MASK_5": {
  6850. "hide_name": 0,
  6851. "bits": [ 56 ],
  6852. "attributes": {
  6853. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.95-3173.101"
  6854. }
  6855. },
  6856. "MASK_6": {
  6857. "hide_name": 0,
  6858. "bits": [ 55 ],
  6859. "attributes": {
  6860. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.87-3173.93"
  6861. }
  6862. },
  6863. "MASK_7": {
  6864. "hide_name": 0,
  6865. "bits": [ 54 ],
  6866. "attributes": {
  6867. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.79-3173.85"
  6868. }
  6869. },
  6870. "MASK_8": {
  6871. "hide_name": 0,
  6872. "bits": [ 53 ],
  6873. "attributes": {
  6874. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.71-3173.77"
  6875. }
  6876. },
  6877. "MASK_9": {
  6878. "hide_name": 0,
  6879. "bits": [ 52 ],
  6880. "attributes": {
  6881. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3173.63-3173.69"
  6882. }
  6883. },
  6884. "RADDR_0": {
  6885. "hide_name": 0,
  6886. "bits": [ 31 ],
  6887. "attributes": {
  6888. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.100-3170.107"
  6889. }
  6890. },
  6891. "RADDR_1": {
  6892. "hide_name": 0,
  6893. "bits": [ 30 ],
  6894. "attributes": {
  6895. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.91-3170.98"
  6896. }
  6897. },
  6898. "RADDR_10": {
  6899. "hide_name": 0,
  6900. "bits": [ 21 ],
  6901. "attributes": {
  6902. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.9-3170.17"
  6903. }
  6904. },
  6905. "RADDR_2": {
  6906. "hide_name": 0,
  6907. "bits": [ 29 ],
  6908. "attributes": {
  6909. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.82-3170.89"
  6910. }
  6911. },
  6912. "RADDR_3": {
  6913. "hide_name": 0,
  6914. "bits": [ 28 ],
  6915. "attributes": {
  6916. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.73-3170.80"
  6917. }
  6918. },
  6919. "RADDR_4": {
  6920. "hide_name": 0,
  6921. "bits": [ 27 ],
  6922. "attributes": {
  6923. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.64-3170.71"
  6924. }
  6925. },
  6926. "RADDR_5": {
  6927. "hide_name": 0,
  6928. "bits": [ 26 ],
  6929. "attributes": {
  6930. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.55-3170.62"
  6931. }
  6932. },
  6933. "RADDR_6": {
  6934. "hide_name": 0,
  6935. "bits": [ 25 ],
  6936. "attributes": {
  6937. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.46-3170.53"
  6938. }
  6939. },
  6940. "RADDR_7": {
  6941. "hide_name": 0,
  6942. "bits": [ 24 ],
  6943. "attributes": {
  6944. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.37-3170.44"
  6945. }
  6946. },
  6947. "RADDR_8": {
  6948. "hide_name": 0,
  6949. "bits": [ 23 ],
  6950. "attributes": {
  6951. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.28-3170.35"
  6952. }
  6953. },
  6954. "RADDR_9": {
  6955. "hide_name": 0,
  6956. "bits": [ 22 ],
  6957. "attributes": {
  6958. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3170.19-3170.26"
  6959. }
  6960. },
  6961. "RCLK": {
  6962. "hide_name": 0,
  6963. "bits": [ 18 ],
  6964. "attributes": {
  6965. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3169.9-3169.13"
  6966. }
  6967. },
  6968. "RCLKE": {
  6969. "hide_name": 0,
  6970. "bits": [ 19 ],
  6971. "attributes": {
  6972. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3169.15-3169.20"
  6973. }
  6974. },
  6975. "RDATA_0": {
  6976. "hide_name": 0,
  6977. "bits": [ 17 ],
  6978. "attributes": {
  6979. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.150-3168.157"
  6980. }
  6981. },
  6982. "RDATA_1": {
  6983. "hide_name": 0,
  6984. "bits": [ 16 ],
  6985. "attributes": {
  6986. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.141-3168.148"
  6987. }
  6988. },
  6989. "RDATA_10": {
  6990. "hide_name": 0,
  6991. "bits": [ 7 ],
  6992. "attributes": {
  6993. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.59-3168.67"
  6994. }
  6995. },
  6996. "RDATA_11": {
  6997. "hide_name": 0,
  6998. "bits": [ 6 ],
  6999. "attributes": {
  7000. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.49-3168.57"
  7001. }
  7002. },
  7003. "RDATA_12": {
  7004. "hide_name": 0,
  7005. "bits": [ 5 ],
  7006. "attributes": {
  7007. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.39-3168.47"
  7008. }
  7009. },
  7010. "RDATA_13": {
  7011. "hide_name": 0,
  7012. "bits": [ 4 ],
  7013. "attributes": {
  7014. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.29-3168.37"
  7015. }
  7016. },
  7017. "RDATA_14": {
  7018. "hide_name": 0,
  7019. "bits": [ 3 ],
  7020. "attributes": {
  7021. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.19-3168.27"
  7022. }
  7023. },
  7024. "RDATA_15": {
  7025. "hide_name": 0,
  7026. "bits": [ 2 ],
  7027. "attributes": {
  7028. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.9-3168.17"
  7029. }
  7030. },
  7031. "RDATA_2": {
  7032. "hide_name": 0,
  7033. "bits": [ 15 ],
  7034. "attributes": {
  7035. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.132-3168.139"
  7036. }
  7037. },
  7038. "RDATA_3": {
  7039. "hide_name": 0,
  7040. "bits": [ 14 ],
  7041. "attributes": {
  7042. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.123-3168.130"
  7043. }
  7044. },
  7045. "RDATA_4": {
  7046. "hide_name": 0,
  7047. "bits": [ 13 ],
  7048. "attributes": {
  7049. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.114-3168.121"
  7050. }
  7051. },
  7052. "RDATA_5": {
  7053. "hide_name": 0,
  7054. "bits": [ 12 ],
  7055. "attributes": {
  7056. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.105-3168.112"
  7057. }
  7058. },
  7059. "RDATA_6": {
  7060. "hide_name": 0,
  7061. "bits": [ 11 ],
  7062. "attributes": {
  7063. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.96-3168.103"
  7064. }
  7065. },
  7066. "RDATA_7": {
  7067. "hide_name": 0,
  7068. "bits": [ 10 ],
  7069. "attributes": {
  7070. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.87-3168.94"
  7071. }
  7072. },
  7073. "RDATA_8": {
  7074. "hide_name": 0,
  7075. "bits": [ 9 ],
  7076. "attributes": {
  7077. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.78-3168.85"
  7078. }
  7079. },
  7080. "RDATA_9": {
  7081. "hide_name": 0,
  7082. "bits": [ 8 ],
  7083. "attributes": {
  7084. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3168.69-3168.76"
  7085. }
  7086. },
  7087. "RE": {
  7088. "hide_name": 0,
  7089. "bits": [ 20 ],
  7090. "attributes": {
  7091. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3169.22-3169.24"
  7092. }
  7093. },
  7094. "WADDR_0": {
  7095. "hide_name": 0,
  7096. "bits": [ 45 ],
  7097. "attributes": {
  7098. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.100-3172.107"
  7099. }
  7100. },
  7101. "WADDR_1": {
  7102. "hide_name": 0,
  7103. "bits": [ 44 ],
  7104. "attributes": {
  7105. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.91-3172.98"
  7106. }
  7107. },
  7108. "WADDR_10": {
  7109. "hide_name": 0,
  7110. "bits": [ 35 ],
  7111. "attributes": {
  7112. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.9-3172.17"
  7113. }
  7114. },
  7115. "WADDR_2": {
  7116. "hide_name": 0,
  7117. "bits": [ 43 ],
  7118. "attributes": {
  7119. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.82-3172.89"
  7120. }
  7121. },
  7122. "WADDR_3": {
  7123. "hide_name": 0,
  7124. "bits": [ 42 ],
  7125. "attributes": {
  7126. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.73-3172.80"
  7127. }
  7128. },
  7129. "WADDR_4": {
  7130. "hide_name": 0,
  7131. "bits": [ 41 ],
  7132. "attributes": {
  7133. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.64-3172.71"
  7134. }
  7135. },
  7136. "WADDR_5": {
  7137. "hide_name": 0,
  7138. "bits": [ 40 ],
  7139. "attributes": {
  7140. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.55-3172.62"
  7141. }
  7142. },
  7143. "WADDR_6": {
  7144. "hide_name": 0,
  7145. "bits": [ 39 ],
  7146. "attributes": {
  7147. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.46-3172.53"
  7148. }
  7149. },
  7150. "WADDR_7": {
  7151. "hide_name": 0,
  7152. "bits": [ 38 ],
  7153. "attributes": {
  7154. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.37-3172.44"
  7155. }
  7156. },
  7157. "WADDR_8": {
  7158. "hide_name": 0,
  7159. "bits": [ 37 ],
  7160. "attributes": {
  7161. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.28-3172.35"
  7162. }
  7163. },
  7164. "WADDR_9": {
  7165. "hide_name": 0,
  7166. "bits": [ 36 ],
  7167. "attributes": {
  7168. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3172.19-3172.26"
  7169. }
  7170. },
  7171. "WCLK": {
  7172. "hide_name": 0,
  7173. "bits": [ 32 ],
  7174. "attributes": {
  7175. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3171.9-3171.13"
  7176. }
  7177. },
  7178. "WCLKE": {
  7179. "hide_name": 0,
  7180. "bits": [ 33 ],
  7181. "attributes": {
  7182. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3171.15-3171.20"
  7183. }
  7184. },
  7185. "WDATA_0": {
  7186. "hide_name": 0,
  7187. "bits": [ 77 ],
  7188. "attributes": {
  7189. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.150-3174.157"
  7190. }
  7191. },
  7192. "WDATA_1": {
  7193. "hide_name": 0,
  7194. "bits": [ 76 ],
  7195. "attributes": {
  7196. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.141-3174.148"
  7197. }
  7198. },
  7199. "WDATA_10": {
  7200. "hide_name": 0,
  7201. "bits": [ 67 ],
  7202. "attributes": {
  7203. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.59-3174.67"
  7204. }
  7205. },
  7206. "WDATA_11": {
  7207. "hide_name": 0,
  7208. "bits": [ 66 ],
  7209. "attributes": {
  7210. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.49-3174.57"
  7211. }
  7212. },
  7213. "WDATA_12": {
  7214. "hide_name": 0,
  7215. "bits": [ 65 ],
  7216. "attributes": {
  7217. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.39-3174.47"
  7218. }
  7219. },
  7220. "WDATA_13": {
  7221. "hide_name": 0,
  7222. "bits": [ 64 ],
  7223. "attributes": {
  7224. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.29-3174.37"
  7225. }
  7226. },
  7227. "WDATA_14": {
  7228. "hide_name": 0,
  7229. "bits": [ 63 ],
  7230. "attributes": {
  7231. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.19-3174.27"
  7232. }
  7233. },
  7234. "WDATA_15": {
  7235. "hide_name": 0,
  7236. "bits": [ 62 ],
  7237. "attributes": {
  7238. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.9-3174.17"
  7239. }
  7240. },
  7241. "WDATA_2": {
  7242. "hide_name": 0,
  7243. "bits": [ 75 ],
  7244. "attributes": {
  7245. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.132-3174.139"
  7246. }
  7247. },
  7248. "WDATA_3": {
  7249. "hide_name": 0,
  7250. "bits": [ 74 ],
  7251. "attributes": {
  7252. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.123-3174.130"
  7253. }
  7254. },
  7255. "WDATA_4": {
  7256. "hide_name": 0,
  7257. "bits": [ 73 ],
  7258. "attributes": {
  7259. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.114-3174.121"
  7260. }
  7261. },
  7262. "WDATA_5": {
  7263. "hide_name": 0,
  7264. "bits": [ 72 ],
  7265. "attributes": {
  7266. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.105-3174.112"
  7267. }
  7268. },
  7269. "WDATA_6": {
  7270. "hide_name": 0,
  7271. "bits": [ 71 ],
  7272. "attributes": {
  7273. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.96-3174.103"
  7274. }
  7275. },
  7276. "WDATA_7": {
  7277. "hide_name": 0,
  7278. "bits": [ 70 ],
  7279. "attributes": {
  7280. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.87-3174.94"
  7281. }
  7282. },
  7283. "WDATA_8": {
  7284. "hide_name": 0,
  7285. "bits": [ 69 ],
  7286. "attributes": {
  7287. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.78-3174.85"
  7288. }
  7289. },
  7290. "WDATA_9": {
  7291. "hide_name": 0,
  7292. "bits": [ 68 ],
  7293. "attributes": {
  7294. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3174.69-3174.76"
  7295. }
  7296. },
  7297. "WE": {
  7298. "hide_name": 0,
  7299. "bits": [ 34 ],
  7300. "attributes": {
  7301. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3171.22-3171.24"
  7302. }
  7303. }
  7304. }
  7305. },
  7306. "SB_CARRY": {
  7307. "attributes": {
  7308. "blackbox": "00000000000000000000000000000001",
  7309. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:228.1-260.10"
  7310. },
  7311. "ports": {
  7312. "CO": {
  7313. "direction": "output",
  7314. "bits": [ 2 ]
  7315. },
  7316. "I0": {
  7317. "direction": "input",
  7318. "bits": [ 3 ]
  7319. },
  7320. "I1": {
  7321. "direction": "input",
  7322. "bits": [ 4 ]
  7323. },
  7324. "CI": {
  7325. "direction": "input",
  7326. "bits": [ 5 ]
  7327. }
  7328. },
  7329. "cells": {
  7330. },
  7331. "netnames": {
  7332. "CI": {
  7333. "hide_name": 0,
  7334. "bits": [ 5 ],
  7335. "attributes": {
  7336. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:228.43-228.45"
  7337. }
  7338. },
  7339. "CO": {
  7340. "hide_name": 0,
  7341. "bits": [ 2 ],
  7342. "attributes": {
  7343. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:228.25-228.27"
  7344. }
  7345. },
  7346. "I0": {
  7347. "hide_name": 0,
  7348. "bits": [ 3 ],
  7349. "attributes": {
  7350. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:228.35-228.37"
  7351. }
  7352. },
  7353. "I1": {
  7354. "hide_name": 0,
  7355. "bits": [ 4 ],
  7356. "attributes": {
  7357. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:228.39-228.41"
  7358. }
  7359. }
  7360. }
  7361. },
  7362. "SB_DFF": {
  7363. "attributes": {
  7364. "abc9_flop": "00000000000000000000000000000001",
  7365. "blackbox": "00000000000000000000000000000001",
  7366. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:265.1-300.10"
  7367. },
  7368. "ports": {
  7369. "Q": {
  7370. "direction": "output",
  7371. "bits": [ 2 ]
  7372. },
  7373. "C": {
  7374. "direction": "input",
  7375. "bits": [ 3 ]
  7376. },
  7377. "D": {
  7378. "direction": "input",
  7379. "bits": [ 4 ]
  7380. }
  7381. },
  7382. "cells": {
  7383. },
  7384. "netnames": {
  7385. "C": {
  7386. "hide_name": 0,
  7387. "bits": [ 3 ],
  7388. "attributes": {
  7389. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:267.8-267.9"
  7390. }
  7391. },
  7392. "D": {
  7393. "hide_name": 0,
  7394. "bits": [ 4 ],
  7395. "attributes": {
  7396. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:267.11-267.12"
  7397. }
  7398. },
  7399. "Q": {
  7400. "hide_name": 0,
  7401. "bits": [ 2 ],
  7402. "attributes": {
  7403. "init": "0",
  7404. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:266.13-266.14"
  7405. }
  7406. }
  7407. }
  7408. },
  7409. "SB_DFFE": {
  7410. "attributes": {
  7411. "abc9_flop": "00000000000000000000000000000001",
  7412. "blackbox": "00000000000000000000000000000001",
  7413. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:303.1-347.10"
  7414. },
  7415. "ports": {
  7416. "Q": {
  7417. "direction": "output",
  7418. "bits": [ 2 ]
  7419. },
  7420. "C": {
  7421. "direction": "input",
  7422. "bits": [ 3 ]
  7423. },
  7424. "E": {
  7425. "direction": "input",
  7426. "bits": [ 4 ]
  7427. },
  7428. "D": {
  7429. "direction": "input",
  7430. "bits": [ 5 ]
  7431. }
  7432. },
  7433. "cells": {
  7434. },
  7435. "netnames": {
  7436. "C": {
  7437. "hide_name": 0,
  7438. "bits": [ 3 ],
  7439. "attributes": {
  7440. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:305.8-305.9"
  7441. }
  7442. },
  7443. "D": {
  7444. "hide_name": 0,
  7445. "bits": [ 5 ],
  7446. "attributes": {
  7447. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:307.8-307.9"
  7448. }
  7449. },
  7450. "E": {
  7451. "hide_name": 0,
  7452. "bits": [ 4 ],
  7453. "attributes": {
  7454. "defaultvalue": "1",
  7455. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:306.8-306.9"
  7456. }
  7457. },
  7458. "Q": {
  7459. "hide_name": 0,
  7460. "bits": [ 2 ],
  7461. "attributes": {
  7462. "init": "0",
  7463. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:304.13-304.14"
  7464. }
  7465. }
  7466. }
  7467. },
  7468. "SB_DFFER": {
  7469. "attributes": {
  7470. "abc9_bypass": "00000000000000000000000000000001",
  7471. "blackbox": "00000000000000000000000000000001",
  7472. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:653.1-730.10"
  7473. },
  7474. "ports": {
  7475. "Q": {
  7476. "direction": "output",
  7477. "bits": [ 2 ]
  7478. },
  7479. "C": {
  7480. "direction": "input",
  7481. "bits": [ 3 ]
  7482. },
  7483. "E": {
  7484. "direction": "input",
  7485. "bits": [ 4 ]
  7486. },
  7487. "R": {
  7488. "direction": "input",
  7489. "bits": [ 5 ]
  7490. },
  7491. "D": {
  7492. "direction": "input",
  7493. "bits": [ 6 ]
  7494. }
  7495. },
  7496. "cells": {
  7497. },
  7498. "netnames": {
  7499. "C": {
  7500. "hide_name": 0,
  7501. "bits": [ 3 ],
  7502. "attributes": {
  7503. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:655.8-655.9"
  7504. }
  7505. },
  7506. "D": {
  7507. "hide_name": 0,
  7508. "bits": [ 6 ],
  7509. "attributes": {
  7510. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:658.8-658.9"
  7511. }
  7512. },
  7513. "E": {
  7514. "hide_name": 0,
  7515. "bits": [ 4 ],
  7516. "attributes": {
  7517. "defaultvalue": "1",
  7518. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:656.8-656.9"
  7519. }
  7520. },
  7521. "Q": {
  7522. "hide_name": 0,
  7523. "bits": [ 2 ],
  7524. "attributes": {
  7525. "init": "0",
  7526. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:654.13-654.14"
  7527. }
  7528. },
  7529. "R": {
  7530. "hide_name": 0,
  7531. "bits": [ 5 ],
  7532. "attributes": {
  7533. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:657.8-657.9"
  7534. }
  7535. }
  7536. }
  7537. },
  7538. "SB_DFFES": {
  7539. "attributes": {
  7540. "blackbox": "00000000000000000000000000000001",
  7541. "abc9_bypass": "00000000000000000000000000000001",
  7542. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:794.1-871.10"
  7543. },
  7544. "ports": {
  7545. "Q": {
  7546. "direction": "output",
  7547. "bits": [ 2 ]
  7548. },
  7549. "C": {
  7550. "direction": "input",
  7551. "bits": [ 3 ]
  7552. },
  7553. "E": {
  7554. "direction": "input",
  7555. "bits": [ 4 ]
  7556. },
  7557. "S": {
  7558. "direction": "input",
  7559. "bits": [ 5 ]
  7560. },
  7561. "D": {
  7562. "direction": "input",
  7563. "bits": [ 6 ]
  7564. }
  7565. },
  7566. "cells": {
  7567. },
  7568. "netnames": {
  7569. "C": {
  7570. "hide_name": 0,
  7571. "bits": [ 3 ],
  7572. "attributes": {
  7573. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:796.8-796.9"
  7574. }
  7575. },
  7576. "D": {
  7577. "hide_name": 0,
  7578. "bits": [ 6 ],
  7579. "attributes": {
  7580. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:799.8-799.9"
  7581. }
  7582. },
  7583. "E": {
  7584. "hide_name": 0,
  7585. "bits": [ 4 ],
  7586. "attributes": {
  7587. "defaultvalue": "1",
  7588. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:797.8-797.9"
  7589. }
  7590. },
  7591. "Q": {
  7592. "hide_name": 0,
  7593. "bits": [ 2 ],
  7594. "attributes": {
  7595. "init": "0",
  7596. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:795.13-795.14"
  7597. }
  7598. },
  7599. "S": {
  7600. "hide_name": 0,
  7601. "bits": [ 5 ],
  7602. "attributes": {
  7603. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:798.8-798.9"
  7604. }
  7605. }
  7606. }
  7607. },
  7608. "SB_DFFESR": {
  7609. "attributes": {
  7610. "abc9_flop": "00000000000000000000000000000001",
  7611. "blackbox": "00000000000000000000000000000001",
  7612. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:592.1-650.10"
  7613. },
  7614. "ports": {
  7615. "Q": {
  7616. "direction": "output",
  7617. "bits": [ 2 ]
  7618. },
  7619. "C": {
  7620. "direction": "input",
  7621. "bits": [ 3 ]
  7622. },
  7623. "E": {
  7624. "direction": "input",
  7625. "bits": [ 4 ]
  7626. },
  7627. "R": {
  7628. "direction": "input",
  7629. "bits": [ 5 ]
  7630. },
  7631. "D": {
  7632. "direction": "input",
  7633. "bits": [ 6 ]
  7634. }
  7635. },
  7636. "cells": {
  7637. },
  7638. "netnames": {
  7639. "C": {
  7640. "hide_name": 0,
  7641. "bits": [ 3 ],
  7642. "attributes": {
  7643. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:594.8-594.9"
  7644. }
  7645. },
  7646. "D": {
  7647. "hide_name": 0,
  7648. "bits": [ 6 ],
  7649. "attributes": {
  7650. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:597.8-597.9"
  7651. }
  7652. },
  7653. "E": {
  7654. "hide_name": 0,
  7655. "bits": [ 4 ],
  7656. "attributes": {
  7657. "defaultvalue": "1",
  7658. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:595.8-595.9"
  7659. }
  7660. },
  7661. "Q": {
  7662. "hide_name": 0,
  7663. "bits": [ 2 ],
  7664. "attributes": {
  7665. "init": "0",
  7666. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:593.13-593.14"
  7667. }
  7668. },
  7669. "R": {
  7670. "hide_name": 0,
  7671. "bits": [ 5 ],
  7672. "attributes": {
  7673. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:596.8-596.9"
  7674. }
  7675. }
  7676. }
  7677. },
  7678. "SB_DFFESS": {
  7679. "attributes": {
  7680. "abc9_flop": "00000000000000000000000000000001",
  7681. "blackbox": "00000000000000000000000000000001",
  7682. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:733.1-791.10"
  7683. },
  7684. "ports": {
  7685. "Q": {
  7686. "direction": "output",
  7687. "bits": [ 2 ]
  7688. },
  7689. "C": {
  7690. "direction": "input",
  7691. "bits": [ 3 ]
  7692. },
  7693. "E": {
  7694. "direction": "input",
  7695. "bits": [ 4 ]
  7696. },
  7697. "S": {
  7698. "direction": "input",
  7699. "bits": [ 5 ]
  7700. },
  7701. "D": {
  7702. "direction": "input",
  7703. "bits": [ 6 ]
  7704. }
  7705. },
  7706. "cells": {
  7707. },
  7708. "netnames": {
  7709. "C": {
  7710. "hide_name": 0,
  7711. "bits": [ 3 ],
  7712. "attributes": {
  7713. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:735.8-735.9"
  7714. }
  7715. },
  7716. "D": {
  7717. "hide_name": 0,
  7718. "bits": [ 6 ],
  7719. "attributes": {
  7720. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:738.8-738.9"
  7721. }
  7722. },
  7723. "E": {
  7724. "hide_name": 0,
  7725. "bits": [ 4 ],
  7726. "attributes": {
  7727. "defaultvalue": "1",
  7728. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:736.8-736.9"
  7729. }
  7730. },
  7731. "Q": {
  7732. "hide_name": 0,
  7733. "bits": [ 2 ],
  7734. "attributes": {
  7735. "init": "0",
  7736. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:734.13-734.14"
  7737. }
  7738. },
  7739. "S": {
  7740. "hide_name": 0,
  7741. "bits": [ 5 ],
  7742. "attributes": {
  7743. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:737.8-737.9"
  7744. }
  7745. }
  7746. }
  7747. },
  7748. "SB_DFFN": {
  7749. "attributes": {
  7750. "blackbox": "00000000000000000000000000000001",
  7751. "abc9_flop": "00000000000000000000000000000001",
  7752. "cells_not_processed": "00000000000000000000000000000001",
  7753. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:876.1-911.10"
  7754. },
  7755. "ports": {
  7756. "Q": {
  7757. "direction": "output",
  7758. "bits": [ 2 ]
  7759. },
  7760. "C": {
  7761. "direction": "input",
  7762. "bits": [ 3 ]
  7763. },
  7764. "D": {
  7765. "direction": "input",
  7766. "bits": [ 4 ]
  7767. }
  7768. },
  7769. "cells": {
  7770. },
  7771. "netnames": {
  7772. "C": {
  7773. "hide_name": 0,
  7774. "bits": [ 3 ],
  7775. "attributes": {
  7776. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:878.8-878.9"
  7777. }
  7778. },
  7779. "D": {
  7780. "hide_name": 0,
  7781. "bits": [ 4 ],
  7782. "attributes": {
  7783. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:878.11-878.12"
  7784. }
  7785. },
  7786. "Q": {
  7787. "hide_name": 0,
  7788. "bits": [ 2 ],
  7789. "attributes": {
  7790. "init": "0",
  7791. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:877.13-877.14"
  7792. }
  7793. }
  7794. }
  7795. },
  7796. "SB_DFFNE": {
  7797. "attributes": {
  7798. "blackbox": "00000000000000000000000000000001",
  7799. "abc9_flop": "00000000000000000000000000000001",
  7800. "cells_not_processed": "00000000000000000000000000000001",
  7801. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:914.1-958.10"
  7802. },
  7803. "ports": {
  7804. "Q": {
  7805. "direction": "output",
  7806. "bits": [ 2 ]
  7807. },
  7808. "C": {
  7809. "direction": "input",
  7810. "bits": [ 3 ]
  7811. },
  7812. "E": {
  7813. "direction": "input",
  7814. "bits": [ 4 ]
  7815. },
  7816. "D": {
  7817. "direction": "input",
  7818. "bits": [ 5 ]
  7819. }
  7820. },
  7821. "cells": {
  7822. },
  7823. "netnames": {
  7824. "C": {
  7825. "hide_name": 0,
  7826. "bits": [ 3 ],
  7827. "attributes": {
  7828. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:916.8-916.9"
  7829. }
  7830. },
  7831. "D": {
  7832. "hide_name": 0,
  7833. "bits": [ 5 ],
  7834. "attributes": {
  7835. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:918.8-918.9"
  7836. }
  7837. },
  7838. "E": {
  7839. "hide_name": 0,
  7840. "bits": [ 4 ],
  7841. "attributes": {
  7842. "defaultvalue": "1",
  7843. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:917.8-917.9"
  7844. }
  7845. },
  7846. "Q": {
  7847. "hide_name": 0,
  7848. "bits": [ 2 ],
  7849. "attributes": {
  7850. "init": "0",
  7851. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:915.13-915.14"
  7852. }
  7853. }
  7854. }
  7855. },
  7856. "SB_DFFNER": {
  7857. "attributes": {
  7858. "blackbox": "00000000000000000000000000000001",
  7859. "cells_not_processed": "00000000000000000000000000000001",
  7860. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1264.1-1341.10"
  7861. },
  7862. "ports": {
  7863. "Q": {
  7864. "direction": "output",
  7865. "bits": [ 2 ]
  7866. },
  7867. "C": {
  7868. "direction": "input",
  7869. "bits": [ 3 ]
  7870. },
  7871. "E": {
  7872. "direction": "input",
  7873. "bits": [ 4 ]
  7874. },
  7875. "R": {
  7876. "direction": "input",
  7877. "bits": [ 5 ]
  7878. },
  7879. "D": {
  7880. "direction": "input",
  7881. "bits": [ 6 ]
  7882. }
  7883. },
  7884. "cells": {
  7885. },
  7886. "netnames": {
  7887. "C": {
  7888. "hide_name": 0,
  7889. "bits": [ 3 ],
  7890. "attributes": {
  7891. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1266.8-1266.9"
  7892. }
  7893. },
  7894. "D": {
  7895. "hide_name": 0,
  7896. "bits": [ 6 ],
  7897. "attributes": {
  7898. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1269.8-1269.9"
  7899. }
  7900. },
  7901. "E": {
  7902. "hide_name": 0,
  7903. "bits": [ 4 ],
  7904. "attributes": {
  7905. "defaultvalue": "1",
  7906. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1267.8-1267.9"
  7907. }
  7908. },
  7909. "Q": {
  7910. "hide_name": 0,
  7911. "bits": [ 2 ],
  7912. "attributes": {
  7913. "init": "0",
  7914. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1265.13-1265.14"
  7915. }
  7916. },
  7917. "R": {
  7918. "hide_name": 0,
  7919. "bits": [ 5 ],
  7920. "attributes": {
  7921. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1268.8-1268.9"
  7922. }
  7923. }
  7924. }
  7925. },
  7926. "SB_DFFNES": {
  7927. "attributes": {
  7928. "blackbox": "00000000000000000000000000000001",
  7929. "cells_not_processed": "00000000000000000000000000000001",
  7930. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1405.1-1483.10"
  7931. },
  7932. "ports": {
  7933. "Q": {
  7934. "direction": "output",
  7935. "bits": [ 2 ]
  7936. },
  7937. "C": {
  7938. "direction": "input",
  7939. "bits": [ 3 ]
  7940. },
  7941. "E": {
  7942. "direction": "input",
  7943. "bits": [ 4 ]
  7944. },
  7945. "S": {
  7946. "direction": "input",
  7947. "bits": [ 5 ]
  7948. },
  7949. "D": {
  7950. "direction": "input",
  7951. "bits": [ 6 ]
  7952. }
  7953. },
  7954. "cells": {
  7955. },
  7956. "netnames": {
  7957. "C": {
  7958. "hide_name": 0,
  7959. "bits": [ 3 ],
  7960. "attributes": {
  7961. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1407.8-1407.9"
  7962. }
  7963. },
  7964. "D": {
  7965. "hide_name": 0,
  7966. "bits": [ 6 ],
  7967. "attributes": {
  7968. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1410.8-1410.9"
  7969. }
  7970. },
  7971. "E": {
  7972. "hide_name": 0,
  7973. "bits": [ 4 ],
  7974. "attributes": {
  7975. "defaultvalue": "1",
  7976. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1408.8-1408.9"
  7977. }
  7978. },
  7979. "Q": {
  7980. "hide_name": 0,
  7981. "bits": [ 2 ],
  7982. "attributes": {
  7983. "init": "0",
  7984. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1406.13-1406.14"
  7985. }
  7986. },
  7987. "S": {
  7988. "hide_name": 0,
  7989. "bits": [ 5 ],
  7990. "attributes": {
  7991. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1409.8-1409.9"
  7992. }
  7993. }
  7994. }
  7995. },
  7996. "SB_DFFNESR": {
  7997. "attributes": {
  7998. "blackbox": "00000000000000000000000000000001",
  7999. "abc9_flop": "00000000000000000000000000000001",
  8000. "cells_not_processed": "00000000000000000000000000000001",
  8001. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1203.1-1261.10"
  8002. },
  8003. "ports": {
  8004. "Q": {
  8005. "direction": "output",
  8006. "bits": [ 2 ]
  8007. },
  8008. "C": {
  8009. "direction": "input",
  8010. "bits": [ 3 ]
  8011. },
  8012. "E": {
  8013. "direction": "input",
  8014. "bits": [ 4 ]
  8015. },
  8016. "R": {
  8017. "direction": "input",
  8018. "bits": [ 5 ]
  8019. },
  8020. "D": {
  8021. "direction": "input",
  8022. "bits": [ 6 ]
  8023. }
  8024. },
  8025. "cells": {
  8026. },
  8027. "netnames": {
  8028. "C": {
  8029. "hide_name": 0,
  8030. "bits": [ 3 ],
  8031. "attributes": {
  8032. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1205.8-1205.9"
  8033. }
  8034. },
  8035. "D": {
  8036. "hide_name": 0,
  8037. "bits": [ 6 ],
  8038. "attributes": {
  8039. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1208.8-1208.9"
  8040. }
  8041. },
  8042. "E": {
  8043. "hide_name": 0,
  8044. "bits": [ 4 ],
  8045. "attributes": {
  8046. "defaultvalue": "1",
  8047. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1206.8-1206.9"
  8048. }
  8049. },
  8050. "Q": {
  8051. "hide_name": 0,
  8052. "bits": [ 2 ],
  8053. "attributes": {
  8054. "init": "0",
  8055. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1204.13-1204.14"
  8056. }
  8057. },
  8058. "R": {
  8059. "hide_name": 0,
  8060. "bits": [ 5 ],
  8061. "attributes": {
  8062. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1207.8-1207.9"
  8063. }
  8064. }
  8065. }
  8066. },
  8067. "SB_DFFNESS": {
  8068. "attributes": {
  8069. "blackbox": "00000000000000000000000000000001",
  8070. "abc9_flop": "00000000000000000000000000000001",
  8071. "cells_not_processed": "00000000000000000000000000000001",
  8072. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1344.1-1402.10"
  8073. },
  8074. "ports": {
  8075. "Q": {
  8076. "direction": "output",
  8077. "bits": [ 2 ]
  8078. },
  8079. "C": {
  8080. "direction": "input",
  8081. "bits": [ 3 ]
  8082. },
  8083. "E": {
  8084. "direction": "input",
  8085. "bits": [ 4 ]
  8086. },
  8087. "S": {
  8088. "direction": "input",
  8089. "bits": [ 5 ]
  8090. },
  8091. "D": {
  8092. "direction": "input",
  8093. "bits": [ 6 ]
  8094. }
  8095. },
  8096. "cells": {
  8097. },
  8098. "netnames": {
  8099. "C": {
  8100. "hide_name": 0,
  8101. "bits": [ 3 ],
  8102. "attributes": {
  8103. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1346.8-1346.9"
  8104. }
  8105. },
  8106. "D": {
  8107. "hide_name": 0,
  8108. "bits": [ 6 ],
  8109. "attributes": {
  8110. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1349.8-1349.9"
  8111. }
  8112. },
  8113. "E": {
  8114. "hide_name": 0,
  8115. "bits": [ 4 ],
  8116. "attributes": {
  8117. "defaultvalue": "1",
  8118. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1347.8-1347.9"
  8119. }
  8120. },
  8121. "Q": {
  8122. "hide_name": 0,
  8123. "bits": [ 2 ],
  8124. "attributes": {
  8125. "init": "0",
  8126. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1345.13-1345.14"
  8127. }
  8128. },
  8129. "S": {
  8130. "hide_name": 0,
  8131. "bits": [ 5 ],
  8132. "attributes": {
  8133. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1348.8-1348.9"
  8134. }
  8135. }
  8136. }
  8137. },
  8138. "SB_DFFNR": {
  8139. "attributes": {
  8140. "blackbox": "00000000000000000000000000000001",
  8141. "abc9_flop": "00000000000000000000000000000001",
  8142. "cells_not_processed": "00000000000000000000000000000001",
  8143. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1011.1-1079.10"
  8144. },
  8145. "ports": {
  8146. "Q": {
  8147. "direction": "output",
  8148. "bits": [ 2 ]
  8149. },
  8150. "C": {
  8151. "direction": "input",
  8152. "bits": [ 3 ]
  8153. },
  8154. "R": {
  8155. "direction": "input",
  8156. "bits": [ 4 ]
  8157. },
  8158. "D": {
  8159. "direction": "input",
  8160. "bits": [ 5 ]
  8161. }
  8162. },
  8163. "cells": {
  8164. },
  8165. "netnames": {
  8166. "C": {
  8167. "hide_name": 0,
  8168. "bits": [ 3 ],
  8169. "attributes": {
  8170. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1013.8-1013.9"
  8171. }
  8172. },
  8173. "D": {
  8174. "hide_name": 0,
  8175. "bits": [ 5 ],
  8176. "attributes": {
  8177. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1013.14-1013.15"
  8178. }
  8179. },
  8180. "Q": {
  8181. "hide_name": 0,
  8182. "bits": [ 2 ],
  8183. "attributes": {
  8184. "init": "0",
  8185. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1012.13-1012.14"
  8186. }
  8187. },
  8188. "R": {
  8189. "hide_name": 0,
  8190. "bits": [ 4 ],
  8191. "attributes": {
  8192. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1013.11-1013.12"
  8193. }
  8194. }
  8195. }
  8196. },
  8197. "SB_DFFNS": {
  8198. "attributes": {
  8199. "blackbox": "00000000000000000000000000000001",
  8200. "cells_not_processed": "00000000000000000000000000000001",
  8201. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1132.1-1200.10"
  8202. },
  8203. "ports": {
  8204. "Q": {
  8205. "direction": "output",
  8206. "bits": [ 2 ]
  8207. },
  8208. "C": {
  8209. "direction": "input",
  8210. "bits": [ 3 ]
  8211. },
  8212. "S": {
  8213. "direction": "input",
  8214. "bits": [ 4 ]
  8215. },
  8216. "D": {
  8217. "direction": "input",
  8218. "bits": [ 5 ]
  8219. }
  8220. },
  8221. "cells": {
  8222. },
  8223. "netnames": {
  8224. "C": {
  8225. "hide_name": 0,
  8226. "bits": [ 3 ],
  8227. "attributes": {
  8228. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1134.8-1134.9"
  8229. }
  8230. },
  8231. "D": {
  8232. "hide_name": 0,
  8233. "bits": [ 5 ],
  8234. "attributes": {
  8235. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1134.14-1134.15"
  8236. }
  8237. },
  8238. "Q": {
  8239. "hide_name": 0,
  8240. "bits": [ 2 ],
  8241. "attributes": {
  8242. "init": "0",
  8243. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1133.13-1133.14"
  8244. }
  8245. },
  8246. "S": {
  8247. "hide_name": 0,
  8248. "bits": [ 4 ],
  8249. "attributes": {
  8250. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1134.11-1134.12"
  8251. }
  8252. }
  8253. }
  8254. },
  8255. "SB_DFFNSR": {
  8256. "attributes": {
  8257. "blackbox": "00000000000000000000000000000001",
  8258. "abc9_flop": "00000000000000000000000000000001",
  8259. "cells_not_processed": "00000000000000000000000000000001",
  8260. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:961.1-1008.10"
  8261. },
  8262. "ports": {
  8263. "Q": {
  8264. "direction": "output",
  8265. "bits": [ 2 ]
  8266. },
  8267. "C": {
  8268. "direction": "input",
  8269. "bits": [ 3 ]
  8270. },
  8271. "R": {
  8272. "direction": "input",
  8273. "bits": [ 4 ]
  8274. },
  8275. "D": {
  8276. "direction": "input",
  8277. "bits": [ 5 ]
  8278. }
  8279. },
  8280. "cells": {
  8281. },
  8282. "netnames": {
  8283. "C": {
  8284. "hide_name": 0,
  8285. "bits": [ 3 ],
  8286. "attributes": {
  8287. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:963.8-963.9"
  8288. }
  8289. },
  8290. "D": {
  8291. "hide_name": 0,
  8292. "bits": [ 5 ],
  8293. "attributes": {
  8294. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:963.14-963.15"
  8295. }
  8296. },
  8297. "Q": {
  8298. "hide_name": 0,
  8299. "bits": [ 2 ],
  8300. "attributes": {
  8301. "init": "0",
  8302. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:962.13-962.14"
  8303. }
  8304. },
  8305. "R": {
  8306. "hide_name": 0,
  8307. "bits": [ 4 ],
  8308. "attributes": {
  8309. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:963.11-963.12"
  8310. }
  8311. }
  8312. }
  8313. },
  8314. "SB_DFFNSS": {
  8315. "attributes": {
  8316. "blackbox": "00000000000000000000000000000001",
  8317. "abc9_flop": "00000000000000000000000000000001",
  8318. "cells_not_processed": "00000000000000000000000000000001",
  8319. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1082.1-1129.10"
  8320. },
  8321. "ports": {
  8322. "Q": {
  8323. "direction": "output",
  8324. "bits": [ 2 ]
  8325. },
  8326. "C": {
  8327. "direction": "input",
  8328. "bits": [ 3 ]
  8329. },
  8330. "S": {
  8331. "direction": "input",
  8332. "bits": [ 4 ]
  8333. },
  8334. "D": {
  8335. "direction": "input",
  8336. "bits": [ 5 ]
  8337. }
  8338. },
  8339. "cells": {
  8340. },
  8341. "netnames": {
  8342. "C": {
  8343. "hide_name": 0,
  8344. "bits": [ 3 ],
  8345. "attributes": {
  8346. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1084.8-1084.9"
  8347. }
  8348. },
  8349. "D": {
  8350. "hide_name": 0,
  8351. "bits": [ 5 ],
  8352. "attributes": {
  8353. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1084.14-1084.15"
  8354. }
  8355. },
  8356. "Q": {
  8357. "hide_name": 0,
  8358. "bits": [ 2 ],
  8359. "attributes": {
  8360. "init": "0",
  8361. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1083.13-1083.14"
  8362. }
  8363. },
  8364. "S": {
  8365. "hide_name": 0,
  8366. "bits": [ 4 ],
  8367. "attributes": {
  8368. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1084.11-1084.12"
  8369. }
  8370. }
  8371. }
  8372. },
  8373. "SB_DFFR": {
  8374. "attributes": {
  8375. "abc9_bypass": "00000000000000000000000000000001",
  8376. "blackbox": "00000000000000000000000000000001",
  8377. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:400.1-468.10"
  8378. },
  8379. "ports": {
  8380. "Q": {
  8381. "direction": "output",
  8382. "bits": [ 2 ]
  8383. },
  8384. "C": {
  8385. "direction": "input",
  8386. "bits": [ 3 ]
  8387. },
  8388. "R": {
  8389. "direction": "input",
  8390. "bits": [ 4 ]
  8391. },
  8392. "D": {
  8393. "direction": "input",
  8394. "bits": [ 5 ]
  8395. }
  8396. },
  8397. "cells": {
  8398. },
  8399. "netnames": {
  8400. "C": {
  8401. "hide_name": 0,
  8402. "bits": [ 3 ],
  8403. "attributes": {
  8404. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:402.8-402.9"
  8405. }
  8406. },
  8407. "D": {
  8408. "hide_name": 0,
  8409. "bits": [ 5 ],
  8410. "attributes": {
  8411. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:402.14-402.15"
  8412. }
  8413. },
  8414. "Q": {
  8415. "hide_name": 0,
  8416. "bits": [ 2 ],
  8417. "attributes": {
  8418. "init": "0",
  8419. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:401.13-401.14"
  8420. }
  8421. },
  8422. "R": {
  8423. "hide_name": 0,
  8424. "bits": [ 4 ],
  8425. "attributes": {
  8426. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:402.11-402.12"
  8427. }
  8428. }
  8429. }
  8430. },
  8431. "SB_DFFS": {
  8432. "attributes": {
  8433. "blackbox": "00000000000000000000000000000001",
  8434. "abc9_bypass": "00000000000000000000000000000001",
  8435. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:521.1-589.10"
  8436. },
  8437. "ports": {
  8438. "Q": {
  8439. "direction": "output",
  8440. "bits": [ 2 ]
  8441. },
  8442. "C": {
  8443. "direction": "input",
  8444. "bits": [ 3 ]
  8445. },
  8446. "S": {
  8447. "direction": "input",
  8448. "bits": [ 4 ]
  8449. },
  8450. "D": {
  8451. "direction": "input",
  8452. "bits": [ 5 ]
  8453. }
  8454. },
  8455. "cells": {
  8456. },
  8457. "netnames": {
  8458. "C": {
  8459. "hide_name": 0,
  8460. "bits": [ 3 ],
  8461. "attributes": {
  8462. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:523.8-523.9"
  8463. }
  8464. },
  8465. "D": {
  8466. "hide_name": 0,
  8467. "bits": [ 5 ],
  8468. "attributes": {
  8469. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:523.14-523.15"
  8470. }
  8471. },
  8472. "Q": {
  8473. "hide_name": 0,
  8474. "bits": [ 2 ],
  8475. "attributes": {
  8476. "init": "0",
  8477. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:522.13-522.14"
  8478. }
  8479. },
  8480. "S": {
  8481. "hide_name": 0,
  8482. "bits": [ 4 ],
  8483. "attributes": {
  8484. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:523.11-523.12"
  8485. }
  8486. }
  8487. }
  8488. },
  8489. "SB_DFFSR": {
  8490. "attributes": {
  8491. "abc9_flop": "00000000000000000000000000000001",
  8492. "blackbox": "00000000000000000000000000000001",
  8493. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:350.1-397.10"
  8494. },
  8495. "ports": {
  8496. "Q": {
  8497. "direction": "output",
  8498. "bits": [ 2 ]
  8499. },
  8500. "C": {
  8501. "direction": "input",
  8502. "bits": [ 3 ]
  8503. },
  8504. "R": {
  8505. "direction": "input",
  8506. "bits": [ 4 ]
  8507. },
  8508. "D": {
  8509. "direction": "input",
  8510. "bits": [ 5 ]
  8511. }
  8512. },
  8513. "cells": {
  8514. },
  8515. "netnames": {
  8516. "C": {
  8517. "hide_name": 0,
  8518. "bits": [ 3 ],
  8519. "attributes": {
  8520. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:352.8-352.9"
  8521. }
  8522. },
  8523. "D": {
  8524. "hide_name": 0,
  8525. "bits": [ 5 ],
  8526. "attributes": {
  8527. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:352.14-352.15"
  8528. }
  8529. },
  8530. "Q": {
  8531. "hide_name": 0,
  8532. "bits": [ 2 ],
  8533. "attributes": {
  8534. "init": "0",
  8535. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:351.13-351.14"
  8536. }
  8537. },
  8538. "R": {
  8539. "hide_name": 0,
  8540. "bits": [ 4 ],
  8541. "attributes": {
  8542. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:352.11-352.12"
  8543. }
  8544. }
  8545. }
  8546. },
  8547. "SB_DFFSS": {
  8548. "attributes": {
  8549. "abc9_flop": "00000000000000000000000000000001",
  8550. "blackbox": "00000000000000000000000000000001",
  8551. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:471.1-518.10"
  8552. },
  8553. "ports": {
  8554. "Q": {
  8555. "direction": "output",
  8556. "bits": [ 2 ]
  8557. },
  8558. "C": {
  8559. "direction": "input",
  8560. "bits": [ 3 ]
  8561. },
  8562. "S": {
  8563. "direction": "input",
  8564. "bits": [ 4 ]
  8565. },
  8566. "D": {
  8567. "direction": "input",
  8568. "bits": [ 5 ]
  8569. }
  8570. },
  8571. "cells": {
  8572. },
  8573. "netnames": {
  8574. "C": {
  8575. "hide_name": 0,
  8576. "bits": [ 3 ],
  8577. "attributes": {
  8578. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:473.8-473.9"
  8579. }
  8580. },
  8581. "D": {
  8582. "hide_name": 0,
  8583. "bits": [ 5 ],
  8584. "attributes": {
  8585. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:473.14-473.15"
  8586. }
  8587. },
  8588. "Q": {
  8589. "hide_name": 0,
  8590. "bits": [ 2 ],
  8591. "attributes": {
  8592. "init": "0",
  8593. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:472.13-472.14"
  8594. }
  8595. },
  8596. "S": {
  8597. "hide_name": 0,
  8598. "bits": [ 4 ],
  8599. "attributes": {
  8600. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:473.11-473.12"
  8601. }
  8602. }
  8603. }
  8604. },
  8605. "SB_FILTER_50NS": {
  8606. "attributes": {
  8607. "blackbox": "00000000000000000000000000000001",
  8608. "cells_not_processed": "00000000000000000000000000000001",
  8609. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2856.1-2860.10"
  8610. },
  8611. "ports": {
  8612. "FILTERIN": {
  8613. "direction": "input",
  8614. "bits": [ 2 ]
  8615. },
  8616. "FILTEROUT": {
  8617. "direction": "output",
  8618. "bits": [ 3 ]
  8619. }
  8620. },
  8621. "cells": {
  8622. },
  8623. "netnames": {
  8624. "FILTERIN": {
  8625. "hide_name": 0,
  8626. "bits": [ 2 ],
  8627. "attributes": {
  8628. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2857.8-2857.16"
  8629. }
  8630. },
  8631. "FILTEROUT": {
  8632. "hide_name": 0,
  8633. "bits": [ 3 ],
  8634. "attributes": {
  8635. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2858.9-2858.18"
  8636. }
  8637. }
  8638. }
  8639. },
  8640. "SB_GB": {
  8641. "attributes": {
  8642. "blackbox": "00000000000000000000000000000001",
  8643. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:162.1-172.10"
  8644. },
  8645. "ports": {
  8646. "USER_SIGNAL_TO_GLOBAL_BUFFER": {
  8647. "direction": "input",
  8648. "bits": [ 2 ]
  8649. },
  8650. "GLOBAL_BUFFER_OUTPUT": {
  8651. "direction": "output",
  8652. "bits": [ 3 ]
  8653. }
  8654. },
  8655. "cells": {
  8656. },
  8657. "netnames": {
  8658. "GLOBAL_BUFFER_OUTPUT": {
  8659. "hide_name": 0,
  8660. "bits": [ 3 ],
  8661. "attributes": {
  8662. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:164.9-164.29"
  8663. }
  8664. },
  8665. "USER_SIGNAL_TO_GLOBAL_BUFFER": {
  8666. "hide_name": 0,
  8667. "bits": [ 2 ],
  8668. "attributes": {
  8669. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:163.9-163.37"
  8670. }
  8671. }
  8672. }
  8673. },
  8674. "SB_GB_IO": {
  8675. "attributes": {
  8676. "blackbox": "00000000000000000000000000000001",
  8677. "cells_not_processed": "00000000000000000000000000000001",
  8678. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:123.1-160.10"
  8679. },
  8680. "parameter_default_values": {
  8681. "IO_STANDARD": "SB_LVCMOS",
  8682. "NEG_TRIGGER": "0",
  8683. "PIN_TYPE": "000000",
  8684. "PULLUP": "0"
  8685. },
  8686. "ports": {
  8687. "PACKAGE_PIN": {
  8688. "direction": "inout",
  8689. "bits": [ 2 ]
  8690. },
  8691. "GLOBAL_BUFFER_OUTPUT": {
  8692. "direction": "output",
  8693. "bits": [ 3 ]
  8694. },
  8695. "LATCH_INPUT_VALUE": {
  8696. "direction": "input",
  8697. "bits": [ 4 ]
  8698. },
  8699. "CLOCK_ENABLE": {
  8700. "direction": "input",
  8701. "bits": [ 5 ]
  8702. },
  8703. "INPUT_CLK": {
  8704. "direction": "input",
  8705. "bits": [ 6 ]
  8706. },
  8707. "OUTPUT_CLK": {
  8708. "direction": "input",
  8709. "bits": [ 7 ]
  8710. },
  8711. "OUTPUT_ENABLE": {
  8712. "direction": "input",
  8713. "bits": [ 8 ]
  8714. },
  8715. "D_OUT_0": {
  8716. "direction": "input",
  8717. "bits": [ 9 ]
  8718. },
  8719. "D_OUT_1": {
  8720. "direction": "input",
  8721. "bits": [ 10 ]
  8722. },
  8723. "D_IN_0": {
  8724. "direction": "output",
  8725. "bits": [ 11 ]
  8726. },
  8727. "D_IN_1": {
  8728. "direction": "output",
  8729. "bits": [ 12 ]
  8730. }
  8731. },
  8732. "cells": {
  8733. },
  8734. "netnames": {
  8735. "CLOCK_ENABLE": {
  8736. "hide_name": 0,
  8737. "bits": [ 5 ],
  8738. "attributes": {
  8739. "defaultvalue": "1",
  8740. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:127.9-127.21"
  8741. }
  8742. },
  8743. "D_IN_0": {
  8744. "hide_name": 0,
  8745. "bits": [ 11 ],
  8746. "attributes": {
  8747. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:133.9-133.15"
  8748. }
  8749. },
  8750. "D_IN_1": {
  8751. "hide_name": 0,
  8752. "bits": [ 12 ],
  8753. "attributes": {
  8754. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:134.9-134.15"
  8755. }
  8756. },
  8757. "D_OUT_0": {
  8758. "hide_name": 0,
  8759. "bits": [ 9 ],
  8760. "attributes": {
  8761. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:131.9-131.16"
  8762. }
  8763. },
  8764. "D_OUT_1": {
  8765. "hide_name": 0,
  8766. "bits": [ 10 ],
  8767. "attributes": {
  8768. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:132.9-132.16"
  8769. }
  8770. },
  8771. "GLOBAL_BUFFER_OUTPUT": {
  8772. "hide_name": 0,
  8773. "bits": [ 3 ],
  8774. "attributes": {
  8775. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:125.9-125.29"
  8776. }
  8777. },
  8778. "INPUT_CLK": {
  8779. "hide_name": 0,
  8780. "bits": [ 6 ],
  8781. "attributes": {
  8782. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:128.9-128.18"
  8783. }
  8784. },
  8785. "LATCH_INPUT_VALUE": {
  8786. "hide_name": 0,
  8787. "bits": [ 4 ],
  8788. "attributes": {
  8789. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:126.9-126.26"
  8790. }
  8791. },
  8792. "OUTPUT_CLK": {
  8793. "hide_name": 0,
  8794. "bits": [ 7 ],
  8795. "attributes": {
  8796. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:129.9-129.19"
  8797. }
  8798. },
  8799. "OUTPUT_ENABLE": {
  8800. "hide_name": 0,
  8801. "bits": [ 8 ],
  8802. "attributes": {
  8803. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:130.9-130.22"
  8804. }
  8805. },
  8806. "PACKAGE_PIN": {
  8807. "hide_name": 0,
  8808. "bits": [ 2 ],
  8809. "attributes": {
  8810. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:124.9-124.20"
  8811. }
  8812. }
  8813. }
  8814. },
  8815. "SB_HFOSC": {
  8816. "attributes": {
  8817. "blackbox": "00000000000000000000000000000001",
  8818. "cells_not_processed": "00000000000000000000000000000001",
  8819. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2664.1-2681.10"
  8820. },
  8821. "parameter_default_values": {
  8822. "CLKHF_DIV": "0b00",
  8823. "TRIM_EN": "0b0"
  8824. },
  8825. "ports": {
  8826. "TRIM0": {
  8827. "direction": "input",
  8828. "bits": [ 2 ]
  8829. },
  8830. "TRIM1": {
  8831. "direction": "input",
  8832. "bits": [ 3 ]
  8833. },
  8834. "TRIM2": {
  8835. "direction": "input",
  8836. "bits": [ 4 ]
  8837. },
  8838. "TRIM3": {
  8839. "direction": "input",
  8840. "bits": [ 5 ]
  8841. },
  8842. "TRIM4": {
  8843. "direction": "input",
  8844. "bits": [ 6 ]
  8845. },
  8846. "TRIM5": {
  8847. "direction": "input",
  8848. "bits": [ 7 ]
  8849. },
  8850. "TRIM6": {
  8851. "direction": "input",
  8852. "bits": [ 8 ]
  8853. },
  8854. "TRIM7": {
  8855. "direction": "input",
  8856. "bits": [ 9 ]
  8857. },
  8858. "TRIM8": {
  8859. "direction": "input",
  8860. "bits": [ 10 ]
  8861. },
  8862. "TRIM9": {
  8863. "direction": "input",
  8864. "bits": [ 11 ]
  8865. },
  8866. "CLKHFPU": {
  8867. "direction": "input",
  8868. "bits": [ 12 ]
  8869. },
  8870. "CLKHFEN": {
  8871. "direction": "input",
  8872. "bits": [ 13 ]
  8873. },
  8874. "CLKHF": {
  8875. "direction": "output",
  8876. "bits": [ 14 ]
  8877. }
  8878. },
  8879. "cells": {
  8880. },
  8881. "netnames": {
  8882. "CLKHF": {
  8883. "hide_name": 0,
  8884. "bits": [ 14 ],
  8885. "attributes": {
  8886. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2677.9-2677.14"
  8887. }
  8888. },
  8889. "CLKHFEN": {
  8890. "hide_name": 0,
  8891. "bits": [ 13 ],
  8892. "attributes": {
  8893. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2676.8-2676.15"
  8894. }
  8895. },
  8896. "CLKHFPU": {
  8897. "hide_name": 0,
  8898. "bits": [ 12 ],
  8899. "attributes": {
  8900. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2675.8-2675.15"
  8901. }
  8902. },
  8903. "TRIM0": {
  8904. "hide_name": 0,
  8905. "bits": [ 2 ],
  8906. "attributes": {
  8907. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2665.8-2665.13"
  8908. }
  8909. },
  8910. "TRIM1": {
  8911. "hide_name": 0,
  8912. "bits": [ 3 ],
  8913. "attributes": {
  8914. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2666.8-2666.13"
  8915. }
  8916. },
  8917. "TRIM2": {
  8918. "hide_name": 0,
  8919. "bits": [ 4 ],
  8920. "attributes": {
  8921. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2667.8-2667.13"
  8922. }
  8923. },
  8924. "TRIM3": {
  8925. "hide_name": 0,
  8926. "bits": [ 5 ],
  8927. "attributes": {
  8928. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2668.8-2668.13"
  8929. }
  8930. },
  8931. "TRIM4": {
  8932. "hide_name": 0,
  8933. "bits": [ 6 ],
  8934. "attributes": {
  8935. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2669.8-2669.13"
  8936. }
  8937. },
  8938. "TRIM5": {
  8939. "hide_name": 0,
  8940. "bits": [ 7 ],
  8941. "attributes": {
  8942. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2670.8-2670.13"
  8943. }
  8944. },
  8945. "TRIM6": {
  8946. "hide_name": 0,
  8947. "bits": [ 8 ],
  8948. "attributes": {
  8949. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2671.8-2671.13"
  8950. }
  8951. },
  8952. "TRIM7": {
  8953. "hide_name": 0,
  8954. "bits": [ 9 ],
  8955. "attributes": {
  8956. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2672.8-2672.13"
  8957. }
  8958. },
  8959. "TRIM8": {
  8960. "hide_name": 0,
  8961. "bits": [ 10 ],
  8962. "attributes": {
  8963. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2673.8-2673.13"
  8964. }
  8965. },
  8966. "TRIM9": {
  8967. "hide_name": 0,
  8968. "bits": [ 11 ],
  8969. "attributes": {
  8970. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2674.8-2674.13"
  8971. }
  8972. }
  8973. }
  8974. },
  8975. "SB_I2C": {
  8976. "attributes": {
  8977. "blackbox": "00000000000000000000000000000001",
  8978. "cells_not_processed": "00000000000000000000000000000001",
  8979. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2733.1-2773.10"
  8980. },
  8981. "parameter_default_values": {
  8982. "BUS_ADDR74": "0b0001",
  8983. "I2C_SLAVE_INIT_ADDR": "0b1111100001"
  8984. },
  8985. "ports": {
  8986. "SBCLKI": {
  8987. "direction": "input",
  8988. "bits": [ 2 ]
  8989. },
  8990. "SBRWI": {
  8991. "direction": "input",
  8992. "bits": [ 3 ]
  8993. },
  8994. "SBSTBI": {
  8995. "direction": "input",
  8996. "bits": [ 4 ]
  8997. },
  8998. "SBADRI7": {
  8999. "direction": "input",
  9000. "bits": [ 5 ]
  9001. },
  9002. "SBADRI6": {
  9003. "direction": "input",
  9004. "bits": [ 6 ]
  9005. },
  9006. "SBADRI5": {
  9007. "direction": "input",
  9008. "bits": [ 7 ]
  9009. },
  9010. "SBADRI4": {
  9011. "direction": "input",
  9012. "bits": [ 8 ]
  9013. },
  9014. "SBADRI3": {
  9015. "direction": "input",
  9016. "bits": [ 9 ]
  9017. },
  9018. "SBADRI2": {
  9019. "direction": "input",
  9020. "bits": [ 10 ]
  9021. },
  9022. "SBADRI1": {
  9023. "direction": "input",
  9024. "bits": [ 11 ]
  9025. },
  9026. "SBADRI0": {
  9027. "direction": "input",
  9028. "bits": [ 12 ]
  9029. },
  9030. "SBDATI7": {
  9031. "direction": "input",
  9032. "bits": [ 13 ]
  9033. },
  9034. "SBDATI6": {
  9035. "direction": "input",
  9036. "bits": [ 14 ]
  9037. },
  9038. "SBDATI5": {
  9039. "direction": "input",
  9040. "bits": [ 15 ]
  9041. },
  9042. "SBDATI4": {
  9043. "direction": "input",
  9044. "bits": [ 16 ]
  9045. },
  9046. "SBDATI3": {
  9047. "direction": "input",
  9048. "bits": [ 17 ]
  9049. },
  9050. "SBDATI2": {
  9051. "direction": "input",
  9052. "bits": [ 18 ]
  9053. },
  9054. "SBDATI1": {
  9055. "direction": "input",
  9056. "bits": [ 19 ]
  9057. },
  9058. "SBDATI0": {
  9059. "direction": "input",
  9060. "bits": [ 20 ]
  9061. },
  9062. "SCLI": {
  9063. "direction": "input",
  9064. "bits": [ 21 ]
  9065. },
  9066. "SDAI": {
  9067. "direction": "input",
  9068. "bits": [ 22 ]
  9069. },
  9070. "SBDATO7": {
  9071. "direction": "output",
  9072. "bits": [ 23 ]
  9073. },
  9074. "SBDATO6": {
  9075. "direction": "output",
  9076. "bits": [ 24 ]
  9077. },
  9078. "SBDATO5": {
  9079. "direction": "output",
  9080. "bits": [ 25 ]
  9081. },
  9082. "SBDATO4": {
  9083. "direction": "output",
  9084. "bits": [ 26 ]
  9085. },
  9086. "SBDATO3": {
  9087. "direction": "output",
  9088. "bits": [ 27 ]
  9089. },
  9090. "SBDATO2": {
  9091. "direction": "output",
  9092. "bits": [ 28 ]
  9093. },
  9094. "SBDATO1": {
  9095. "direction": "output",
  9096. "bits": [ 29 ]
  9097. },
  9098. "SBDATO0": {
  9099. "direction": "output",
  9100. "bits": [ 30 ]
  9101. },
  9102. "SBACKO": {
  9103. "direction": "output",
  9104. "bits": [ 31 ]
  9105. },
  9106. "I2CIRQ": {
  9107. "direction": "output",
  9108. "bits": [ 32 ]
  9109. },
  9110. "I2CWKUP": {
  9111. "direction": "output",
  9112. "bits": [ 33 ]
  9113. },
  9114. "SCLO": {
  9115. "direction": "output",
  9116. "bits": [ 34 ]
  9117. },
  9118. "SCLOE": {
  9119. "direction": "output",
  9120. "bits": [ 35 ]
  9121. },
  9122. "SDAO": {
  9123. "direction": "output",
  9124. "bits": [ 36 ]
  9125. },
  9126. "SDAOE": {
  9127. "direction": "output",
  9128. "bits": [ 37 ]
  9129. }
  9130. },
  9131. "cells": {
  9132. },
  9133. "netnames": {
  9134. "I2CIRQ": {
  9135. "hide_name": 0,
  9136. "bits": [ 32 ],
  9137. "attributes": {
  9138. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2764.9-2764.15"
  9139. }
  9140. },
  9141. "I2CWKUP": {
  9142. "hide_name": 0,
  9143. "bits": [ 33 ],
  9144. "attributes": {
  9145. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2765.9-2765.16"
  9146. }
  9147. },
  9148. "SBACKO": {
  9149. "hide_name": 0,
  9150. "bits": [ 31 ],
  9151. "attributes": {
  9152. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2763.9-2763.15"
  9153. }
  9154. },
  9155. "SBADRI0": {
  9156. "hide_name": 0,
  9157. "bits": [ 12 ],
  9158. "attributes": {
  9159. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2744.9-2744.16"
  9160. }
  9161. },
  9162. "SBADRI1": {
  9163. "hide_name": 0,
  9164. "bits": [ 11 ],
  9165. "attributes": {
  9166. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2743.9-2743.16"
  9167. }
  9168. },
  9169. "SBADRI2": {
  9170. "hide_name": 0,
  9171. "bits": [ 10 ],
  9172. "attributes": {
  9173. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2742.9-2742.16"
  9174. }
  9175. },
  9176. "SBADRI3": {
  9177. "hide_name": 0,
  9178. "bits": [ 9 ],
  9179. "attributes": {
  9180. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2741.9-2741.16"
  9181. }
  9182. },
  9183. "SBADRI4": {
  9184. "hide_name": 0,
  9185. "bits": [ 8 ],
  9186. "attributes": {
  9187. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2740.9-2740.16"
  9188. }
  9189. },
  9190. "SBADRI5": {
  9191. "hide_name": 0,
  9192. "bits": [ 7 ],
  9193. "attributes": {
  9194. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2739.9-2739.16"
  9195. }
  9196. },
  9197. "SBADRI6": {
  9198. "hide_name": 0,
  9199. "bits": [ 6 ],
  9200. "attributes": {
  9201. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2738.9-2738.16"
  9202. }
  9203. },
  9204. "SBADRI7": {
  9205. "hide_name": 0,
  9206. "bits": [ 5 ],
  9207. "attributes": {
  9208. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2737.9-2737.16"
  9209. }
  9210. },
  9211. "SBCLKI": {
  9212. "hide_name": 0,
  9213. "bits": [ 2 ],
  9214. "attributes": {
  9215. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2734.9-2734.15"
  9216. }
  9217. },
  9218. "SBDATI0": {
  9219. "hide_name": 0,
  9220. "bits": [ 20 ],
  9221. "attributes": {
  9222. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2752.9-2752.16"
  9223. }
  9224. },
  9225. "SBDATI1": {
  9226. "hide_name": 0,
  9227. "bits": [ 19 ],
  9228. "attributes": {
  9229. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2751.9-2751.16"
  9230. }
  9231. },
  9232. "SBDATI2": {
  9233. "hide_name": 0,
  9234. "bits": [ 18 ],
  9235. "attributes": {
  9236. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2750.9-2750.16"
  9237. }
  9238. },
  9239. "SBDATI3": {
  9240. "hide_name": 0,
  9241. "bits": [ 17 ],
  9242. "attributes": {
  9243. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2749.9-2749.16"
  9244. }
  9245. },
  9246. "SBDATI4": {
  9247. "hide_name": 0,
  9248. "bits": [ 16 ],
  9249. "attributes": {
  9250. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2748.9-2748.16"
  9251. }
  9252. },
  9253. "SBDATI5": {
  9254. "hide_name": 0,
  9255. "bits": [ 15 ],
  9256. "attributes": {
  9257. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2747.9-2747.16"
  9258. }
  9259. },
  9260. "SBDATI6": {
  9261. "hide_name": 0,
  9262. "bits": [ 14 ],
  9263. "attributes": {
  9264. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2746.9-2746.16"
  9265. }
  9266. },
  9267. "SBDATI7": {
  9268. "hide_name": 0,
  9269. "bits": [ 13 ],
  9270. "attributes": {
  9271. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2745.9-2745.16"
  9272. }
  9273. },
  9274. "SBDATO0": {
  9275. "hide_name": 0,
  9276. "bits": [ 30 ],
  9277. "attributes": {
  9278. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2762.9-2762.16"
  9279. }
  9280. },
  9281. "SBDATO1": {
  9282. "hide_name": 0,
  9283. "bits": [ 29 ],
  9284. "attributes": {
  9285. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2761.9-2761.16"
  9286. }
  9287. },
  9288. "SBDATO2": {
  9289. "hide_name": 0,
  9290. "bits": [ 28 ],
  9291. "attributes": {
  9292. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2760.9-2760.16"
  9293. }
  9294. },
  9295. "SBDATO3": {
  9296. "hide_name": 0,
  9297. "bits": [ 27 ],
  9298. "attributes": {
  9299. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2759.9-2759.16"
  9300. }
  9301. },
  9302. "SBDATO4": {
  9303. "hide_name": 0,
  9304. "bits": [ 26 ],
  9305. "attributes": {
  9306. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2758.9-2758.16"
  9307. }
  9308. },
  9309. "SBDATO5": {
  9310. "hide_name": 0,
  9311. "bits": [ 25 ],
  9312. "attributes": {
  9313. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2757.9-2757.16"
  9314. }
  9315. },
  9316. "SBDATO6": {
  9317. "hide_name": 0,
  9318. "bits": [ 24 ],
  9319. "attributes": {
  9320. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2756.9-2756.16"
  9321. }
  9322. },
  9323. "SBDATO7": {
  9324. "hide_name": 0,
  9325. "bits": [ 23 ],
  9326. "attributes": {
  9327. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2755.9-2755.16"
  9328. }
  9329. },
  9330. "SBRWI": {
  9331. "hide_name": 0,
  9332. "bits": [ 3 ],
  9333. "attributes": {
  9334. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2735.9-2735.14"
  9335. }
  9336. },
  9337. "SBSTBI": {
  9338. "hide_name": 0,
  9339. "bits": [ 4 ],
  9340. "attributes": {
  9341. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2736.9-2736.15"
  9342. }
  9343. },
  9344. "SCLI": {
  9345. "hide_name": 0,
  9346. "bits": [ 21 ],
  9347. "attributes": {
  9348. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2753.9-2753.13"
  9349. }
  9350. },
  9351. "SCLO": {
  9352. "hide_name": 0,
  9353. "bits": [ 34 ],
  9354. "attributes": {
  9355. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2766.9-2766.13"
  9356. }
  9357. },
  9358. "SCLOE": {
  9359. "hide_name": 0,
  9360. "bits": [ 35 ],
  9361. "attributes": {
  9362. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2767.9-2767.14"
  9363. }
  9364. },
  9365. "SDAI": {
  9366. "hide_name": 0,
  9367. "bits": [ 22 ],
  9368. "attributes": {
  9369. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2754.9-2754.13"
  9370. }
  9371. },
  9372. "SDAO": {
  9373. "hide_name": 0,
  9374. "bits": [ 36 ],
  9375. "attributes": {
  9376. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2768.9-2768.13"
  9377. }
  9378. },
  9379. "SDAOE": {
  9380. "hide_name": 0,
  9381. "bits": [ 37 ],
  9382. "attributes": {
  9383. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2769.9-2769.14"
  9384. }
  9385. }
  9386. }
  9387. },
  9388. "SB_IO": {
  9389. "attributes": {
  9390. "blackbox": "00000000000000000000000000000001",
  9391. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:17.1-121.10"
  9392. },
  9393. "parameter_default_values": {
  9394. "IO_STANDARD": "SB_LVCMOS",
  9395. "NEG_TRIGGER": "0",
  9396. "PIN_TYPE": "000000",
  9397. "PULLUP": "0"
  9398. },
  9399. "ports": {
  9400. "PACKAGE_PIN": {
  9401. "direction": "inout",
  9402. "bits": [ 2 ]
  9403. },
  9404. "LATCH_INPUT_VALUE": {
  9405. "direction": "input",
  9406. "bits": [ 3 ]
  9407. },
  9408. "CLOCK_ENABLE": {
  9409. "direction": "input",
  9410. "bits": [ 4 ]
  9411. },
  9412. "INPUT_CLK": {
  9413. "direction": "input",
  9414. "bits": [ 5 ]
  9415. },
  9416. "OUTPUT_CLK": {
  9417. "direction": "input",
  9418. "bits": [ 6 ]
  9419. },
  9420. "OUTPUT_ENABLE": {
  9421. "direction": "input",
  9422. "bits": [ 7 ]
  9423. },
  9424. "D_OUT_0": {
  9425. "direction": "input",
  9426. "bits": [ 8 ]
  9427. },
  9428. "D_OUT_1": {
  9429. "direction": "input",
  9430. "bits": [ 9 ]
  9431. },
  9432. "D_IN_0": {
  9433. "direction": "output",
  9434. "bits": [ 10 ]
  9435. },
  9436. "D_IN_1": {
  9437. "direction": "output",
  9438. "bits": [ 11 ]
  9439. }
  9440. },
  9441. "cells": {
  9442. },
  9443. "netnames": {
  9444. "CLOCK_ENABLE": {
  9445. "hide_name": 0,
  9446. "bits": [ 4 ],
  9447. "attributes": {
  9448. "defaultvalue": "1",
  9449. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:20.9-20.21"
  9450. }
  9451. },
  9452. "D_IN_0": {
  9453. "hide_name": 0,
  9454. "bits": [ 10 ],
  9455. "attributes": {
  9456. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:26.9-26.15"
  9457. }
  9458. },
  9459. "D_IN_1": {
  9460. "hide_name": 0,
  9461. "bits": [ 11 ],
  9462. "attributes": {
  9463. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:27.9-27.15"
  9464. }
  9465. },
  9466. "D_OUT_0": {
  9467. "hide_name": 0,
  9468. "bits": [ 8 ],
  9469. "attributes": {
  9470. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:24.9-24.16"
  9471. }
  9472. },
  9473. "D_OUT_1": {
  9474. "hide_name": 0,
  9475. "bits": [ 9 ],
  9476. "attributes": {
  9477. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:25.9-25.16"
  9478. }
  9479. },
  9480. "INPUT_CLK": {
  9481. "hide_name": 0,
  9482. "bits": [ 5 ],
  9483. "attributes": {
  9484. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:21.9-21.18"
  9485. }
  9486. },
  9487. "LATCH_INPUT_VALUE": {
  9488. "hide_name": 0,
  9489. "bits": [ 3 ],
  9490. "attributes": {
  9491. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:19.9-19.26"
  9492. }
  9493. },
  9494. "OUTPUT_CLK": {
  9495. "hide_name": 0,
  9496. "bits": [ 6 ],
  9497. "attributes": {
  9498. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:22.9-22.19"
  9499. }
  9500. },
  9501. "OUTPUT_ENABLE": {
  9502. "hide_name": 0,
  9503. "bits": [ 7 ],
  9504. "attributes": {
  9505. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:23.9-23.22"
  9506. }
  9507. },
  9508. "PACKAGE_PIN": {
  9509. "hide_name": 0,
  9510. "bits": [ 2 ],
  9511. "attributes": {
  9512. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:18.9-18.20"
  9513. }
  9514. }
  9515. }
  9516. },
  9517. "SB_IO_I3C": {
  9518. "attributes": {
  9519. "blackbox": "00000000000000000000000000000001",
  9520. "cells_not_processed": "00000000000000000000000000000001",
  9521. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2862.1-2929.10"
  9522. },
  9523. "parameter_default_values": {
  9524. "IO_STANDARD": "SB_LVCMOS",
  9525. "NEG_TRIGGER": "0",
  9526. "PIN_TYPE": "000000",
  9527. "PULLUP": "0",
  9528. "WEAK_PULLUP": "0"
  9529. },
  9530. "ports": {
  9531. "PACKAGE_PIN": {
  9532. "direction": "inout",
  9533. "bits": [ 2 ]
  9534. },
  9535. "LATCH_INPUT_VALUE": {
  9536. "direction": "input",
  9537. "bits": [ 3 ]
  9538. },
  9539. "CLOCK_ENABLE": {
  9540. "direction": "input",
  9541. "bits": [ 4 ]
  9542. },
  9543. "INPUT_CLK": {
  9544. "direction": "input",
  9545. "bits": [ 5 ]
  9546. },
  9547. "OUTPUT_CLK": {
  9548. "direction": "input",
  9549. "bits": [ 6 ]
  9550. },
  9551. "OUTPUT_ENABLE": {
  9552. "direction": "input",
  9553. "bits": [ 7 ]
  9554. },
  9555. "D_OUT_0": {
  9556. "direction": "input",
  9557. "bits": [ 8 ]
  9558. },
  9559. "D_OUT_1": {
  9560. "direction": "input",
  9561. "bits": [ 9 ]
  9562. },
  9563. "D_IN_0": {
  9564. "direction": "output",
  9565. "bits": [ 10 ]
  9566. },
  9567. "D_IN_1": {
  9568. "direction": "output",
  9569. "bits": [ 11 ]
  9570. },
  9571. "PU_ENB": {
  9572. "direction": "input",
  9573. "bits": [ 12 ]
  9574. },
  9575. "WEAK_PU_ENB": {
  9576. "direction": "input",
  9577. "bits": [ 13 ]
  9578. }
  9579. },
  9580. "cells": {
  9581. },
  9582. "netnames": {
  9583. "CLOCK_ENABLE": {
  9584. "hide_name": 0,
  9585. "bits": [ 4 ],
  9586. "attributes": {
  9587. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2865.9-2865.21"
  9588. }
  9589. },
  9590. "D_IN_0": {
  9591. "hide_name": 0,
  9592. "bits": [ 10 ],
  9593. "attributes": {
  9594. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2871.9-2871.15"
  9595. }
  9596. },
  9597. "D_IN_1": {
  9598. "hide_name": 0,
  9599. "bits": [ 11 ],
  9600. "attributes": {
  9601. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2872.9-2872.15"
  9602. }
  9603. },
  9604. "D_OUT_0": {
  9605. "hide_name": 0,
  9606. "bits": [ 8 ],
  9607. "attributes": {
  9608. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2869.9-2869.16"
  9609. }
  9610. },
  9611. "D_OUT_1": {
  9612. "hide_name": 0,
  9613. "bits": [ 9 ],
  9614. "attributes": {
  9615. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2870.9-2870.16"
  9616. }
  9617. },
  9618. "INPUT_CLK": {
  9619. "hide_name": 0,
  9620. "bits": [ 5 ],
  9621. "attributes": {
  9622. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2866.9-2866.18"
  9623. }
  9624. },
  9625. "LATCH_INPUT_VALUE": {
  9626. "hide_name": 0,
  9627. "bits": [ 3 ],
  9628. "attributes": {
  9629. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2864.9-2864.26"
  9630. }
  9631. },
  9632. "OUTPUT_CLK": {
  9633. "hide_name": 0,
  9634. "bits": [ 6 ],
  9635. "attributes": {
  9636. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2867.9-2867.19"
  9637. }
  9638. },
  9639. "OUTPUT_ENABLE": {
  9640. "hide_name": 0,
  9641. "bits": [ 7 ],
  9642. "attributes": {
  9643. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2868.9-2868.22"
  9644. }
  9645. },
  9646. "PACKAGE_PIN": {
  9647. "hide_name": 0,
  9648. "bits": [ 2 ],
  9649. "attributes": {
  9650. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2863.9-2863.20"
  9651. }
  9652. },
  9653. "PU_ENB": {
  9654. "hide_name": 0,
  9655. "bits": [ 12 ],
  9656. "attributes": {
  9657. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2873.9-2873.15"
  9658. }
  9659. },
  9660. "WEAK_PU_ENB": {
  9661. "hide_name": 0,
  9662. "bits": [ 13 ],
  9663. "attributes": {
  9664. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2874.9-2874.20"
  9665. }
  9666. }
  9667. }
  9668. },
  9669. "SB_IO_OD": {
  9670. "attributes": {
  9671. "blackbox": "00000000000000000000000000000001",
  9672. "cells_not_processed": "00000000000000000000000000000001",
  9673. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2931.1-2993.10"
  9674. },
  9675. "parameter_default_values": {
  9676. "NEG_TRIGGER": "0",
  9677. "PIN_TYPE": "000000"
  9678. },
  9679. "ports": {
  9680. "PACKAGEPIN": {
  9681. "direction": "inout",
  9682. "bits": [ 2 ]
  9683. },
  9684. "LATCHINPUTVALUE": {
  9685. "direction": "input",
  9686. "bits": [ 3 ]
  9687. },
  9688. "CLOCKENABLE": {
  9689. "direction": "input",
  9690. "bits": [ 4 ]
  9691. },
  9692. "INPUTCLK": {
  9693. "direction": "input",
  9694. "bits": [ 5 ]
  9695. },
  9696. "OUTPUTCLK": {
  9697. "direction": "input",
  9698. "bits": [ 6 ]
  9699. },
  9700. "OUTPUTENABLE": {
  9701. "direction": "input",
  9702. "bits": [ 7 ]
  9703. },
  9704. "DOUT1": {
  9705. "direction": "input",
  9706. "bits": [ 8 ]
  9707. },
  9708. "DOUT0": {
  9709. "direction": "input",
  9710. "bits": [ 9 ]
  9711. },
  9712. "DIN1": {
  9713. "direction": "output",
  9714. "bits": [ 10 ]
  9715. },
  9716. "DIN0": {
  9717. "direction": "output",
  9718. "bits": [ 11 ]
  9719. }
  9720. },
  9721. "cells": {
  9722. },
  9723. "netnames": {
  9724. "CLOCKENABLE": {
  9725. "hide_name": 0,
  9726. "bits": [ 4 ],
  9727. "attributes": {
  9728. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2934.9-2934.20"
  9729. }
  9730. },
  9731. "DIN0": {
  9732. "hide_name": 0,
  9733. "bits": [ 11 ],
  9734. "attributes": {
  9735. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2941.9-2941.13"
  9736. }
  9737. },
  9738. "DIN1": {
  9739. "hide_name": 0,
  9740. "bits": [ 10 ],
  9741. "attributes": {
  9742. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2940.9-2940.13"
  9743. }
  9744. },
  9745. "DOUT0": {
  9746. "hide_name": 0,
  9747. "bits": [ 9 ],
  9748. "attributes": {
  9749. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2939.9-2939.14"
  9750. }
  9751. },
  9752. "DOUT1": {
  9753. "hide_name": 0,
  9754. "bits": [ 8 ],
  9755. "attributes": {
  9756. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2938.9-2938.14"
  9757. }
  9758. },
  9759. "INPUTCLK": {
  9760. "hide_name": 0,
  9761. "bits": [ 5 ],
  9762. "attributes": {
  9763. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2935.9-2935.17"
  9764. }
  9765. },
  9766. "LATCHINPUTVALUE": {
  9767. "hide_name": 0,
  9768. "bits": [ 3 ],
  9769. "attributes": {
  9770. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2933.9-2933.24"
  9771. }
  9772. },
  9773. "OUTPUTCLK": {
  9774. "hide_name": 0,
  9775. "bits": [ 6 ],
  9776. "attributes": {
  9777. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2936.9-2936.18"
  9778. }
  9779. },
  9780. "OUTPUTENABLE": {
  9781. "hide_name": 0,
  9782. "bits": [ 7 ],
  9783. "attributes": {
  9784. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2937.9-2937.21"
  9785. }
  9786. },
  9787. "PACKAGEPIN": {
  9788. "hide_name": 0,
  9789. "bits": [ 2 ],
  9790. "attributes": {
  9791. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2932.9-2932.19"
  9792. }
  9793. }
  9794. }
  9795. },
  9796. "SB_LEDDA_IP": {
  9797. "attributes": {
  9798. "blackbox": "00000000000000000000000000000001",
  9799. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2830.1-2853.10"
  9800. },
  9801. "ports": {
  9802. "LEDDCS": {
  9803. "direction": "input",
  9804. "bits": [ 2 ]
  9805. },
  9806. "LEDDCLK": {
  9807. "direction": "input",
  9808. "bits": [ 3 ]
  9809. },
  9810. "LEDDDAT7": {
  9811. "direction": "input",
  9812. "bits": [ 4 ]
  9813. },
  9814. "LEDDDAT6": {
  9815. "direction": "input",
  9816. "bits": [ 5 ]
  9817. },
  9818. "LEDDDAT5": {
  9819. "direction": "input",
  9820. "bits": [ 6 ]
  9821. },
  9822. "LEDDDAT4": {
  9823. "direction": "input",
  9824. "bits": [ 7 ]
  9825. },
  9826. "LEDDDAT3": {
  9827. "direction": "input",
  9828. "bits": [ 8 ]
  9829. },
  9830. "LEDDDAT2": {
  9831. "direction": "input",
  9832. "bits": [ 9 ]
  9833. },
  9834. "LEDDDAT1": {
  9835. "direction": "input",
  9836. "bits": [ 10 ]
  9837. },
  9838. "LEDDDAT0": {
  9839. "direction": "input",
  9840. "bits": [ 11 ]
  9841. },
  9842. "LEDDADDR3": {
  9843. "direction": "input",
  9844. "bits": [ 12 ]
  9845. },
  9846. "LEDDADDR2": {
  9847. "direction": "input",
  9848. "bits": [ 13 ]
  9849. },
  9850. "LEDDADDR1": {
  9851. "direction": "input",
  9852. "bits": [ 14 ]
  9853. },
  9854. "LEDDADDR0": {
  9855. "direction": "input",
  9856. "bits": [ 15 ]
  9857. },
  9858. "LEDDDEN": {
  9859. "direction": "input",
  9860. "bits": [ 16 ]
  9861. },
  9862. "LEDDEXE": {
  9863. "direction": "input",
  9864. "bits": [ 17 ]
  9865. },
  9866. "LEDDRST": {
  9867. "direction": "input",
  9868. "bits": [ 18 ]
  9869. },
  9870. "PWMOUT0": {
  9871. "direction": "output",
  9872. "bits": [ 19 ]
  9873. },
  9874. "PWMOUT1": {
  9875. "direction": "output",
  9876. "bits": [ 20 ]
  9877. },
  9878. "PWMOUT2": {
  9879. "direction": "output",
  9880. "bits": [ 21 ]
  9881. },
  9882. "LEDDON": {
  9883. "direction": "output",
  9884. "bits": [ 22 ]
  9885. }
  9886. },
  9887. "cells": {
  9888. },
  9889. "netnames": {
  9890. "LEDDADDR0": {
  9891. "hide_name": 0,
  9892. "bits": [ 15 ],
  9893. "attributes": {
  9894. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2844.8-2844.17"
  9895. }
  9896. },
  9897. "LEDDADDR1": {
  9898. "hide_name": 0,
  9899. "bits": [ 14 ],
  9900. "attributes": {
  9901. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2843.8-2843.17"
  9902. }
  9903. },
  9904. "LEDDADDR2": {
  9905. "hide_name": 0,
  9906. "bits": [ 13 ],
  9907. "attributes": {
  9908. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2842.8-2842.17"
  9909. }
  9910. },
  9911. "LEDDADDR3": {
  9912. "hide_name": 0,
  9913. "bits": [ 12 ],
  9914. "attributes": {
  9915. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2841.8-2841.17"
  9916. }
  9917. },
  9918. "LEDDCLK": {
  9919. "hide_name": 0,
  9920. "bits": [ 3 ],
  9921. "attributes": {
  9922. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2832.8-2832.15"
  9923. }
  9924. },
  9925. "LEDDCS": {
  9926. "hide_name": 0,
  9927. "bits": [ 2 ],
  9928. "attributes": {
  9929. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2831.8-2831.14"
  9930. }
  9931. },
  9932. "LEDDDAT0": {
  9933. "hide_name": 0,
  9934. "bits": [ 11 ],
  9935. "attributes": {
  9936. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2840.8-2840.16"
  9937. }
  9938. },
  9939. "LEDDDAT1": {
  9940. "hide_name": 0,
  9941. "bits": [ 10 ],
  9942. "attributes": {
  9943. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2839.8-2839.16"
  9944. }
  9945. },
  9946. "LEDDDAT2": {
  9947. "hide_name": 0,
  9948. "bits": [ 9 ],
  9949. "attributes": {
  9950. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2838.8-2838.16"
  9951. }
  9952. },
  9953. "LEDDDAT3": {
  9954. "hide_name": 0,
  9955. "bits": [ 8 ],
  9956. "attributes": {
  9957. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2837.8-2837.16"
  9958. }
  9959. },
  9960. "LEDDDAT4": {
  9961. "hide_name": 0,
  9962. "bits": [ 7 ],
  9963. "attributes": {
  9964. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2836.8-2836.16"
  9965. }
  9966. },
  9967. "LEDDDAT5": {
  9968. "hide_name": 0,
  9969. "bits": [ 6 ],
  9970. "attributes": {
  9971. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2835.8-2835.16"
  9972. }
  9973. },
  9974. "LEDDDAT6": {
  9975. "hide_name": 0,
  9976. "bits": [ 5 ],
  9977. "attributes": {
  9978. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2834.8-2834.16"
  9979. }
  9980. },
  9981. "LEDDDAT7": {
  9982. "hide_name": 0,
  9983. "bits": [ 4 ],
  9984. "attributes": {
  9985. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2833.8-2833.16"
  9986. }
  9987. },
  9988. "LEDDDEN": {
  9989. "hide_name": 0,
  9990. "bits": [ 16 ],
  9991. "attributes": {
  9992. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2845.8-2845.15"
  9993. }
  9994. },
  9995. "LEDDEXE": {
  9996. "hide_name": 0,
  9997. "bits": [ 17 ],
  9998. "attributes": {
  9999. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2846.8-2846.15"
  10000. }
  10001. },
  10002. "LEDDON": {
  10003. "hide_name": 0,
  10004. "bits": [ 22 ],
  10005. "attributes": {
  10006. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2851.9-2851.15"
  10007. }
  10008. },
  10009. "LEDDRST": {
  10010. "hide_name": 0,
  10011. "bits": [ 18 ],
  10012. "attributes": {
  10013. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2847.8-2847.15"
  10014. }
  10015. },
  10016. "PWMOUT0": {
  10017. "hide_name": 0,
  10018. "bits": [ 19 ],
  10019. "attributes": {
  10020. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2848.9-2848.16"
  10021. }
  10022. },
  10023. "PWMOUT1": {
  10024. "hide_name": 0,
  10025. "bits": [ 20 ],
  10026. "attributes": {
  10027. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2849.9-2849.16"
  10028. }
  10029. },
  10030. "PWMOUT2": {
  10031. "hide_name": 0,
  10032. "bits": [ 21 ],
  10033. "attributes": {
  10034. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2850.9-2850.16"
  10035. }
  10036. }
  10037. }
  10038. },
  10039. "SB_LED_DRV_CUR": {
  10040. "attributes": {
  10041. "blackbox": "00000000000000000000000000000001",
  10042. "cells_not_processed": "00000000000000000000000000000001",
  10043. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2709.1-2713.10"
  10044. },
  10045. "ports": {
  10046. "EN": {
  10047. "direction": "input",
  10048. "bits": [ 2 ]
  10049. },
  10050. "LEDPU": {
  10051. "direction": "output",
  10052. "bits": [ 3 ]
  10053. }
  10054. },
  10055. "cells": {
  10056. },
  10057. "netnames": {
  10058. "EN": {
  10059. "hide_name": 0,
  10060. "bits": [ 2 ],
  10061. "attributes": {
  10062. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2710.8-2710.10"
  10063. }
  10064. },
  10065. "LEDPU": {
  10066. "hide_name": 0,
  10067. "bits": [ 3 ],
  10068. "attributes": {
  10069. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2711.9-2711.14"
  10070. }
  10071. }
  10072. }
  10073. },
  10074. "SB_LFOSC": {
  10075. "attributes": {
  10076. "blackbox": "00000000000000000000000000000001",
  10077. "cells_not_processed": "00000000000000000000000000000001",
  10078. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2684.1-2689.10"
  10079. },
  10080. "ports": {
  10081. "CLKLFPU": {
  10082. "direction": "input",
  10083. "bits": [ 2 ]
  10084. },
  10085. "CLKLFEN": {
  10086. "direction": "input",
  10087. "bits": [ 3 ]
  10088. },
  10089. "CLKLF": {
  10090. "direction": "output",
  10091. "bits": [ 4 ]
  10092. }
  10093. },
  10094. "cells": {
  10095. },
  10096. "netnames": {
  10097. "CLKLF": {
  10098. "hide_name": 0,
  10099. "bits": [ 4 ],
  10100. "attributes": {
  10101. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2687.9-2687.14"
  10102. }
  10103. },
  10104. "CLKLFEN": {
  10105. "hide_name": 0,
  10106. "bits": [ 3 ],
  10107. "attributes": {
  10108. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2686.8-2686.15"
  10109. }
  10110. },
  10111. "CLKLFPU": {
  10112. "hide_name": 0,
  10113. "bits": [ 2 ],
  10114. "attributes": {
  10115. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2685.8-2685.15"
  10116. }
  10117. }
  10118. }
  10119. },
  10120. "SB_LUT4": {
  10121. "attributes": {
  10122. "abc9_lut": "00000000000000000000000000000001",
  10123. "blackbox": "00000000000000000000000000000001",
  10124. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:177.1-225.10"
  10125. },
  10126. "parameter_default_values": {
  10127. "LUT_INIT": "0000000000000000"
  10128. },
  10129. "ports": {
  10130. "O": {
  10131. "direction": "output",
  10132. "bits": [ 2 ]
  10133. },
  10134. "I0": {
  10135. "direction": "input",
  10136. "bits": [ 3 ]
  10137. },
  10138. "I1": {
  10139. "direction": "input",
  10140. "bits": [ 4 ]
  10141. },
  10142. "I2": {
  10143. "direction": "input",
  10144. "bits": [ 5 ]
  10145. },
  10146. "I3": {
  10147. "direction": "input",
  10148. "bits": [ 6 ]
  10149. }
  10150. },
  10151. "cells": {
  10152. },
  10153. "netnames": {
  10154. "I0": {
  10155. "hide_name": 0,
  10156. "bits": [ 3 ],
  10157. "attributes": {
  10158. "defaultvalue": "0",
  10159. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:179.8-179.10"
  10160. }
  10161. },
  10162. "I1": {
  10163. "hide_name": 0,
  10164. "bits": [ 4 ],
  10165. "attributes": {
  10166. "defaultvalue": "0",
  10167. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:180.8-180.10"
  10168. }
  10169. },
  10170. "I2": {
  10171. "hide_name": 0,
  10172. "bits": [ 5 ],
  10173. "attributes": {
  10174. "defaultvalue": "0",
  10175. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:181.8-181.10"
  10176. }
  10177. },
  10178. "I3": {
  10179. "hide_name": 0,
  10180. "bits": [ 6 ],
  10181. "attributes": {
  10182. "defaultvalue": "0",
  10183. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:182.8-182.10"
  10184. }
  10185. },
  10186. "O": {
  10187. "hide_name": 0,
  10188. "bits": [ 2 ],
  10189. "attributes": {
  10190. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:178.9-178.10"
  10191. }
  10192. }
  10193. }
  10194. },
  10195. "SB_MAC16": {
  10196. "attributes": {
  10197. "blackbox": "00000000000000000000000000000001",
  10198. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2996.1-3164.10"
  10199. },
  10200. "parameter_default_values": {
  10201. "A_REG": "0",
  10202. "A_SIGNED": "0",
  10203. "BOTADDSUB_CARRYSELECT": "00",
  10204. "BOTADDSUB_LOWERINPUT": "00",
  10205. "BOTADDSUB_UPPERINPUT": "0",
  10206. "BOTOUTPUT_SELECT": "00",
  10207. "BOT_8x8_MULT_REG": "0",
  10208. "B_REG": "0",
  10209. "B_SIGNED": "0",
  10210. "C_REG": "0",
  10211. "D_REG": "0",
  10212. "MODE_8x8": "0",
  10213. "NEG_TRIGGER": "0",
  10214. "PIPELINE_16x16_MULT_REG1": "0",
  10215. "PIPELINE_16x16_MULT_REG2": "0",
  10216. "TOPADDSUB_CARRYSELECT": "00",
  10217. "TOPADDSUB_LOWERINPUT": "00",
  10218. "TOPADDSUB_UPPERINPUT": "0",
  10219. "TOPOUTPUT_SELECT": "00",
  10220. "TOP_8x8_MULT_REG": "0"
  10221. },
  10222. "ports": {
  10223. "CLK": {
  10224. "direction": "input",
  10225. "bits": [ 2 ]
  10226. },
  10227. "CE": {
  10228. "direction": "input",
  10229. "bits": [ 3 ]
  10230. },
  10231. "C": {
  10232. "direction": "input",
  10233. "bits": [ 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19 ]
  10234. },
  10235. "A": {
  10236. "direction": "input",
  10237. "bits": [ 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35 ]
  10238. },
  10239. "B": {
  10240. "direction": "input",
  10241. "bits": [ 36, 37, 38, 39, 40, 41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51 ]
  10242. },
  10243. "D": {
  10244. "direction": "input",
  10245. "bits": [ 52, 53, 54, 55, 56, 57, 58, 59, 60, 61, 62, 63, 64, 65, 66, 67 ]
  10246. },
  10247. "AHOLD": {
  10248. "direction": "input",
  10249. "bits": [ 68 ]
  10250. },
  10251. "BHOLD": {
  10252. "direction": "input",
  10253. "bits": [ 69 ]
  10254. },
  10255. "CHOLD": {
  10256. "direction": "input",
  10257. "bits": [ 70 ]
  10258. },
  10259. "DHOLD": {
  10260. "direction": "input",
  10261. "bits": [ 71 ]
  10262. },
  10263. "IRSTTOP": {
  10264. "direction": "input",
  10265. "bits": [ 72 ]
  10266. },
  10267. "IRSTBOT": {
  10268. "direction": "input",
  10269. "bits": [ 73 ]
  10270. },
  10271. "ORSTTOP": {
  10272. "direction": "input",
  10273. "bits": [ 74 ]
  10274. },
  10275. "ORSTBOT": {
  10276. "direction": "input",
  10277. "bits": [ 75 ]
  10278. },
  10279. "OLOADTOP": {
  10280. "direction": "input",
  10281. "bits": [ 76 ]
  10282. },
  10283. "OLOADBOT": {
  10284. "direction": "input",
  10285. "bits": [ 77 ]
  10286. },
  10287. "ADDSUBTOP": {
  10288. "direction": "input",
  10289. "bits": [ 78 ]
  10290. },
  10291. "ADDSUBBOT": {
  10292. "direction": "input",
  10293. "bits": [ 79 ]
  10294. },
  10295. "OHOLDTOP": {
  10296. "direction": "input",
  10297. "bits": [ 80 ]
  10298. },
  10299. "OHOLDBOT": {
  10300. "direction": "input",
  10301. "bits": [ 81 ]
  10302. },
  10303. "CI": {
  10304. "direction": "input",
  10305. "bits": [ 82 ]
  10306. },
  10307. "ACCUMCI": {
  10308. "direction": "input",
  10309. "bits": [ 83 ]
  10310. },
  10311. "SIGNEXTIN": {
  10312. "direction": "input",
  10313. "bits": [ 84 ]
  10314. },
  10315. "O": {
  10316. "direction": "output",
  10317. "bits": [ 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102, 103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116 ]
  10318. },
  10319. "CO": {
  10320. "direction": "output",
  10321. "bits": [ 117 ]
  10322. },
  10323. "ACCUMCO": {
  10324. "direction": "output",
  10325. "bits": [ 118 ]
  10326. },
  10327. "SIGNEXTOUT": {
  10328. "direction": "output",
  10329. "bits": [ 119 ]
  10330. }
  10331. },
  10332. "cells": {
  10333. },
  10334. "netnames": {
  10335. "A": {
  10336. "hide_name": 0,
  10337. "bits": [ 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35 ],
  10338. "attributes": {
  10339. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2998.18-2998.19"
  10340. }
  10341. },
  10342. "ACCUMCI": {
  10343. "hide_name": 0,
  10344. "bits": [ 83 ],
  10345. "attributes": {
  10346. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3005.12-3005.19"
  10347. }
  10348. },
  10349. "ACCUMCO": {
  10350. "hide_name": 0,
  10351. "bits": [ 118 ],
  10352. "attributes": {
  10353. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3007.13-3007.20"
  10354. }
  10355. },
  10356. "ADDSUBBOT": {
  10357. "hide_name": 0,
  10358. "bits": [ 79 ],
  10359. "attributes": {
  10360. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3003.19-3003.28"
  10361. }
  10362. },
  10363. "ADDSUBTOP": {
  10364. "hide_name": 0,
  10365. "bits": [ 78 ],
  10366. "attributes": {
  10367. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3003.8-3003.17"
  10368. }
  10369. },
  10370. "AHOLD": {
  10371. "hide_name": 0,
  10372. "bits": [ 68 ],
  10373. "attributes": {
  10374. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2999.8-2999.13"
  10375. }
  10376. },
  10377. "B": {
  10378. "hide_name": 0,
  10379. "bits": [ 36, 37, 38, 39, 40, 41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51 ],
  10380. "attributes": {
  10381. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2998.21-2998.22"
  10382. }
  10383. },
  10384. "BHOLD": {
  10385. "hide_name": 0,
  10386. "bits": [ 69 ],
  10387. "attributes": {
  10388. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2999.15-2999.20"
  10389. }
  10390. },
  10391. "C": {
  10392. "hide_name": 0,
  10393. "bits": [ 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19 ],
  10394. "attributes": {
  10395. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2998.15-2998.16"
  10396. }
  10397. },
  10398. "CE": {
  10399. "hide_name": 0,
  10400. "bits": [ 3 ],
  10401. "attributes": {
  10402. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2997.13-2997.15"
  10403. }
  10404. },
  10405. "CHOLD": {
  10406. "hide_name": 0,
  10407. "bits": [ 70 ],
  10408. "attributes": {
  10409. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2999.22-2999.27"
  10410. }
  10411. },
  10412. "CI": {
  10413. "hide_name": 0,
  10414. "bits": [ 82 ],
  10415. "attributes": {
  10416. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3005.8-3005.10"
  10417. }
  10418. },
  10419. "CLK": {
  10420. "hide_name": 0,
  10421. "bits": [ 2 ],
  10422. "attributes": {
  10423. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2997.8-2997.11"
  10424. }
  10425. },
  10426. "CO": {
  10427. "hide_name": 0,
  10428. "bits": [ 117 ],
  10429. "attributes": {
  10430. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3007.9-3007.11"
  10431. }
  10432. },
  10433. "D": {
  10434. "hide_name": 0,
  10435. "bits": [ 52, 53, 54, 55, 56, 57, 58, 59, 60, 61, 62, 63, 64, 65, 66, 67 ],
  10436. "attributes": {
  10437. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2998.24-2998.25"
  10438. }
  10439. },
  10440. "DHOLD": {
  10441. "hide_name": 0,
  10442. "bits": [ 71 ],
  10443. "attributes": {
  10444. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2999.29-2999.34"
  10445. }
  10446. },
  10447. "IRSTBOT": {
  10448. "hide_name": 0,
  10449. "bits": [ 73 ],
  10450. "attributes": {
  10451. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3000.17-3000.24"
  10452. }
  10453. },
  10454. "IRSTTOP": {
  10455. "hide_name": 0,
  10456. "bits": [ 72 ],
  10457. "attributes": {
  10458. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3000.8-3000.15"
  10459. }
  10460. },
  10461. "O": {
  10462. "hide_name": 0,
  10463. "bits": [ 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102, 103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116 ],
  10464. "attributes": {
  10465. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3006.16-3006.17"
  10466. }
  10467. },
  10468. "OHOLDBOT": {
  10469. "hide_name": 0,
  10470. "bits": [ 81 ],
  10471. "attributes": {
  10472. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3004.18-3004.26"
  10473. }
  10474. },
  10475. "OHOLDTOP": {
  10476. "hide_name": 0,
  10477. "bits": [ 80 ],
  10478. "attributes": {
  10479. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3004.8-3004.16"
  10480. }
  10481. },
  10482. "OLOADBOT": {
  10483. "hide_name": 0,
  10484. "bits": [ 77 ],
  10485. "attributes": {
  10486. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3002.18-3002.26"
  10487. }
  10488. },
  10489. "OLOADTOP": {
  10490. "hide_name": 0,
  10491. "bits": [ 76 ],
  10492. "attributes": {
  10493. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3002.8-3002.16"
  10494. }
  10495. },
  10496. "ORSTBOT": {
  10497. "hide_name": 0,
  10498. "bits": [ 75 ],
  10499. "attributes": {
  10500. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3001.17-3001.24"
  10501. }
  10502. },
  10503. "ORSTTOP": {
  10504. "hide_name": 0,
  10505. "bits": [ 74 ],
  10506. "attributes": {
  10507. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3001.8-3001.15"
  10508. }
  10509. },
  10510. "SIGNEXTIN": {
  10511. "hide_name": 0,
  10512. "bits": [ 84 ],
  10513. "attributes": {
  10514. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3005.21-3005.30"
  10515. }
  10516. },
  10517. "SIGNEXTOUT": {
  10518. "hide_name": 0,
  10519. "bits": [ 119 ],
  10520. "attributes": {
  10521. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:3007.22-3007.32"
  10522. }
  10523. }
  10524. }
  10525. },
  10526. "SB_PLL40_2F_CORE": {
  10527. "attributes": {
  10528. "blackbox": "00000000000000000000000000000001",
  10529. "cells_not_processed": "00000000000000000000000000000001",
  10530. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2521.1-2553.10"
  10531. },
  10532. "parameter_default_values": {
  10533. "DELAY_ADJUSTMENT_MODE_FEEDBACK": "FIXED",
  10534. "DELAY_ADJUSTMENT_MODE_RELATIVE": "FIXED",
  10535. "DIVF": "0000000",
  10536. "DIVQ": "000",
  10537. "DIVR": "0000",
  10538. "ENABLE_ICEGATE_PORTA": "0",
  10539. "ENABLE_ICEGATE_PORTB": "0",
  10540. "EXTERNAL_DIVIDE_FACTOR": "00000000000000000000000000000001",
  10541. "FDA_FEEDBACK": "0000",
  10542. "FDA_RELATIVE": "0000",
  10543. "FEEDBACK_PATH": "SIMPLE",
  10544. "FILTER_RANGE": "000",
  10545. "PLLOUT_SELECT_PORTA": "GENCLK",
  10546. "PLLOUT_SELECT_PORTB": "GENCLK",
  10547. "SHIFTREG_DIV_MODE": "0",
  10548. "TEST_MODE": "0"
  10549. },
  10550. "ports": {
  10551. "REFERENCECLK": {
  10552. "direction": "input",
  10553. "bits": [ 2 ]
  10554. },
  10555. "PLLOUTCOREA": {
  10556. "direction": "output",
  10557. "bits": [ 3 ]
  10558. },
  10559. "PLLOUTGLOBALA": {
  10560. "direction": "output",
  10561. "bits": [ 4 ]
  10562. },
  10563. "PLLOUTCOREB": {
  10564. "direction": "output",
  10565. "bits": [ 5 ]
  10566. },
  10567. "PLLOUTGLOBALB": {
  10568. "direction": "output",
  10569. "bits": [ 6 ]
  10570. },
  10571. "EXTFEEDBACK": {
  10572. "direction": "input",
  10573. "bits": [ 7 ]
  10574. },
  10575. "DYNAMICDELAY": {
  10576. "direction": "input",
  10577. "bits": [ 8, 9, 10, 11, 12, 13, 14, 15 ]
  10578. },
  10579. "LOCK": {
  10580. "direction": "output",
  10581. "bits": [ 16 ]
  10582. },
  10583. "BYPASS": {
  10584. "direction": "input",
  10585. "bits": [ 17 ]
  10586. },
  10587. "RESETB": {
  10588. "direction": "input",
  10589. "bits": [ 18 ]
  10590. },
  10591. "LATCHINPUTVALUE": {
  10592. "direction": "input",
  10593. "bits": [ 19 ]
  10594. },
  10595. "SDO": {
  10596. "direction": "output",
  10597. "bits": [ 20 ]
  10598. },
  10599. "SDI": {
  10600. "direction": "input",
  10601. "bits": [ 21 ]
  10602. },
  10603. "SCLK": {
  10604. "direction": "input",
  10605. "bits": [ 22 ]
  10606. }
  10607. },
  10608. "cells": {
  10609. },
  10610. "netnames": {
  10611. "BYPASS": {
  10612. "hide_name": 0,
  10613. "bits": [ 17 ],
  10614. "attributes": {
  10615. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2530.10-2530.16"
  10616. }
  10617. },
  10618. "DYNAMICDELAY": {
  10619. "hide_name": 0,
  10620. "bits": [ 8, 9, 10, 11, 12, 13, 14, 15 ],
  10621. "attributes": {
  10622. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2528.16-2528.28"
  10623. }
  10624. },
  10625. "EXTFEEDBACK": {
  10626. "hide_name": 0,
  10627. "bits": [ 7 ],
  10628. "attributes": {
  10629. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2527.10-2527.21"
  10630. }
  10631. },
  10632. "LATCHINPUTVALUE": {
  10633. "hide_name": 0,
  10634. "bits": [ 19 ],
  10635. "attributes": {
  10636. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2532.10-2532.25"
  10637. }
  10638. },
  10639. "LOCK": {
  10640. "hide_name": 0,
  10641. "bits": [ 16 ],
  10642. "attributes": {
  10643. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2529.10-2529.14"
  10644. }
  10645. },
  10646. "PLLOUTCOREA": {
  10647. "hide_name": 0,
  10648. "bits": [ 3 ],
  10649. "attributes": {
  10650. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2523.10-2523.21"
  10651. }
  10652. },
  10653. "PLLOUTCOREB": {
  10654. "hide_name": 0,
  10655. "bits": [ 5 ],
  10656. "attributes": {
  10657. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2525.10-2525.21"
  10658. }
  10659. },
  10660. "PLLOUTGLOBALA": {
  10661. "hide_name": 0,
  10662. "bits": [ 4 ],
  10663. "attributes": {
  10664. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2524.10-2524.23"
  10665. }
  10666. },
  10667. "PLLOUTGLOBALB": {
  10668. "hide_name": 0,
  10669. "bits": [ 6 ],
  10670. "attributes": {
  10671. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2526.10-2526.23"
  10672. }
  10673. },
  10674. "REFERENCECLK": {
  10675. "hide_name": 0,
  10676. "bits": [ 2 ],
  10677. "attributes": {
  10678. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2522.10-2522.22"
  10679. }
  10680. },
  10681. "RESETB": {
  10682. "hide_name": 0,
  10683. "bits": [ 18 ],
  10684. "attributes": {
  10685. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2531.10-2531.16"
  10686. }
  10687. },
  10688. "SCLK": {
  10689. "hide_name": 0,
  10690. "bits": [ 22 ],
  10691. "attributes": {
  10692. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2535.10-2535.14"
  10693. }
  10694. },
  10695. "SDI": {
  10696. "hide_name": 0,
  10697. "bits": [ 21 ],
  10698. "attributes": {
  10699. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2534.10-2534.13"
  10700. }
  10701. },
  10702. "SDO": {
  10703. "hide_name": 0,
  10704. "bits": [ 20 ],
  10705. "attributes": {
  10706. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2533.10-2533.13"
  10707. }
  10708. }
  10709. }
  10710. },
  10711. "SB_PLL40_2F_PAD": {
  10712. "attributes": {
  10713. "blackbox": "00000000000000000000000000000001",
  10714. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2556.1-2588.10"
  10715. },
  10716. "parameter_default_values": {
  10717. "DELAY_ADJUSTMENT_MODE_FEEDBACK": "FIXED",
  10718. "DELAY_ADJUSTMENT_MODE_RELATIVE": "FIXED",
  10719. "DIVF": "0000000",
  10720. "DIVQ": "000",
  10721. "DIVR": "0000",
  10722. "ENABLE_ICEGATE_PORTA": "0",
  10723. "ENABLE_ICEGATE_PORTB": "0",
  10724. "EXTERNAL_DIVIDE_FACTOR": "00000000000000000000000000000001",
  10725. "FDA_FEEDBACK": "0000",
  10726. "FDA_RELATIVE": "0000",
  10727. "FEEDBACK_PATH": "SIMPLE",
  10728. "FILTER_RANGE": "000",
  10729. "PLLOUT_SELECT_PORTA": "GENCLK",
  10730. "PLLOUT_SELECT_PORTB": "GENCLK",
  10731. "SHIFTREG_DIV_MODE": "00",
  10732. "TEST_MODE": "0"
  10733. },
  10734. "ports": {
  10735. "PACKAGEPIN": {
  10736. "direction": "input",
  10737. "bits": [ 2 ]
  10738. },
  10739. "PLLOUTCOREA": {
  10740. "direction": "output",
  10741. "bits": [ 3 ]
  10742. },
  10743. "PLLOUTGLOBALA": {
  10744. "direction": "output",
  10745. "bits": [ 4 ]
  10746. },
  10747. "PLLOUTCOREB": {
  10748. "direction": "output",
  10749. "bits": [ 5 ]
  10750. },
  10751. "PLLOUTGLOBALB": {
  10752. "direction": "output",
  10753. "bits": [ 6 ]
  10754. },
  10755. "EXTFEEDBACK": {
  10756. "direction": "input",
  10757. "bits": [ 7 ]
  10758. },
  10759. "DYNAMICDELAY": {
  10760. "direction": "input",
  10761. "bits": [ 8, 9, 10, 11, 12, 13, 14, 15 ]
  10762. },
  10763. "LOCK": {
  10764. "direction": "output",
  10765. "bits": [ 16 ]
  10766. },
  10767. "BYPASS": {
  10768. "direction": "input",
  10769. "bits": [ 17 ]
  10770. },
  10771. "RESETB": {
  10772. "direction": "input",
  10773. "bits": [ 18 ]
  10774. },
  10775. "LATCHINPUTVALUE": {
  10776. "direction": "input",
  10777. "bits": [ 19 ]
  10778. },
  10779. "SDO": {
  10780. "direction": "output",
  10781. "bits": [ 20 ]
  10782. },
  10783. "SDI": {
  10784. "direction": "input",
  10785. "bits": [ 21 ]
  10786. },
  10787. "SCLK": {
  10788. "direction": "input",
  10789. "bits": [ 22 ]
  10790. }
  10791. },
  10792. "cells": {
  10793. },
  10794. "netnames": {
  10795. "BYPASS": {
  10796. "hide_name": 0,
  10797. "bits": [ 17 ],
  10798. "attributes": {
  10799. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2565.10-2565.16"
  10800. }
  10801. },
  10802. "DYNAMICDELAY": {
  10803. "hide_name": 0,
  10804. "bits": [ 8, 9, 10, 11, 12, 13, 14, 15 ],
  10805. "attributes": {
  10806. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2563.16-2563.28"
  10807. }
  10808. },
  10809. "EXTFEEDBACK": {
  10810. "hide_name": 0,
  10811. "bits": [ 7 ],
  10812. "attributes": {
  10813. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2562.10-2562.21"
  10814. }
  10815. },
  10816. "LATCHINPUTVALUE": {
  10817. "hide_name": 0,
  10818. "bits": [ 19 ],
  10819. "attributes": {
  10820. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2567.10-2567.25"
  10821. }
  10822. },
  10823. "LOCK": {
  10824. "hide_name": 0,
  10825. "bits": [ 16 ],
  10826. "attributes": {
  10827. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2564.10-2564.14"
  10828. }
  10829. },
  10830. "PACKAGEPIN": {
  10831. "hide_name": 0,
  10832. "bits": [ 2 ],
  10833. "attributes": {
  10834. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2557.10-2557.20"
  10835. }
  10836. },
  10837. "PLLOUTCOREA": {
  10838. "hide_name": 0,
  10839. "bits": [ 3 ],
  10840. "attributes": {
  10841. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2558.10-2558.21"
  10842. }
  10843. },
  10844. "PLLOUTCOREB": {
  10845. "hide_name": 0,
  10846. "bits": [ 5 ],
  10847. "attributes": {
  10848. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2560.10-2560.21"
  10849. }
  10850. },
  10851. "PLLOUTGLOBALA": {
  10852. "hide_name": 0,
  10853. "bits": [ 4 ],
  10854. "attributes": {
  10855. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2559.10-2559.23"
  10856. }
  10857. },
  10858. "PLLOUTGLOBALB": {
  10859. "hide_name": 0,
  10860. "bits": [ 6 ],
  10861. "attributes": {
  10862. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2561.10-2561.23"
  10863. }
  10864. },
  10865. "RESETB": {
  10866. "hide_name": 0,
  10867. "bits": [ 18 ],
  10868. "attributes": {
  10869. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2566.10-2566.16"
  10870. }
  10871. },
  10872. "SCLK": {
  10873. "hide_name": 0,
  10874. "bits": [ 22 ],
  10875. "attributes": {
  10876. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2570.10-2570.14"
  10877. }
  10878. },
  10879. "SDI": {
  10880. "hide_name": 0,
  10881. "bits": [ 21 ],
  10882. "attributes": {
  10883. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2569.10-2569.13"
  10884. }
  10885. },
  10886. "SDO": {
  10887. "hide_name": 0,
  10888. "bits": [ 20 ],
  10889. "attributes": {
  10890. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2568.10-2568.13"
  10891. }
  10892. }
  10893. }
  10894. },
  10895. "SB_PLL40_2_PAD": {
  10896. "attributes": {
  10897. "blackbox": "00000000000000000000000000000001",
  10898. "cells_not_processed": "00000000000000000000000000000001",
  10899. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2487.1-2518.10"
  10900. },
  10901. "parameter_default_values": {
  10902. "DELAY_ADJUSTMENT_MODE_FEEDBACK": "FIXED",
  10903. "DELAY_ADJUSTMENT_MODE_RELATIVE": "FIXED",
  10904. "DIVF": "0000000",
  10905. "DIVQ": "000",
  10906. "DIVR": "0000",
  10907. "ENABLE_ICEGATE_PORTA": "0",
  10908. "ENABLE_ICEGATE_PORTB": "0",
  10909. "EXTERNAL_DIVIDE_FACTOR": "00000000000000000000000000000001",
  10910. "FDA_FEEDBACK": "0000",
  10911. "FDA_RELATIVE": "0000",
  10912. "FEEDBACK_PATH": "SIMPLE",
  10913. "FILTER_RANGE": "000",
  10914. "PLLOUT_SELECT_PORTB": "GENCLK",
  10915. "SHIFTREG_DIV_MODE": "0",
  10916. "TEST_MODE": "0"
  10917. },
  10918. "ports": {
  10919. "PACKAGEPIN": {
  10920. "direction": "input",
  10921. "bits": [ 2 ]
  10922. },
  10923. "PLLOUTCOREA": {
  10924. "direction": "output",
  10925. "bits": [ 3 ]
  10926. },
  10927. "PLLOUTGLOBALA": {
  10928. "direction": "output",
  10929. "bits": [ 4 ]
  10930. },
  10931. "PLLOUTCOREB": {
  10932. "direction": "output",
  10933. "bits": [ 5 ]
  10934. },
  10935. "PLLOUTGLOBALB": {
  10936. "direction": "output",
  10937. "bits": [ 6 ]
  10938. },
  10939. "EXTFEEDBACK": {
  10940. "direction": "input",
  10941. "bits": [ 7 ]
  10942. },
  10943. "DYNAMICDELAY": {
  10944. "direction": "input",
  10945. "bits": [ 8, 9, 10, 11, 12, 13, 14, 15 ]
  10946. },
  10947. "LOCK": {
  10948. "direction": "output",
  10949. "bits": [ 16 ]
  10950. },
  10951. "BYPASS": {
  10952. "direction": "input",
  10953. "bits": [ 17 ]
  10954. },
  10955. "RESETB": {
  10956. "direction": "input",
  10957. "bits": [ 18 ]
  10958. },
  10959. "LATCHINPUTVALUE": {
  10960. "direction": "input",
  10961. "bits": [ 19 ]
  10962. },
  10963. "SDO": {
  10964. "direction": "output",
  10965. "bits": [ 20 ]
  10966. },
  10967. "SDI": {
  10968. "direction": "input",
  10969. "bits": [ 21 ]
  10970. },
  10971. "SCLK": {
  10972. "direction": "input",
  10973. "bits": [ 22 ]
  10974. }
  10975. },
  10976. "cells": {
  10977. },
  10978. "netnames": {
  10979. "BYPASS": {
  10980. "hide_name": 0,
  10981. "bits": [ 17 ],
  10982. "attributes": {
  10983. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2496.10-2496.16"
  10984. }
  10985. },
  10986. "DYNAMICDELAY": {
  10987. "hide_name": 0,
  10988. "bits": [ 8, 9, 10, 11, 12, 13, 14, 15 ],
  10989. "attributes": {
  10990. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2494.16-2494.28"
  10991. }
  10992. },
  10993. "EXTFEEDBACK": {
  10994. "hide_name": 0,
  10995. "bits": [ 7 ],
  10996. "attributes": {
  10997. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2493.10-2493.21"
  10998. }
  10999. },
  11000. "LATCHINPUTVALUE": {
  11001. "hide_name": 0,
  11002. "bits": [ 19 ],
  11003. "attributes": {
  11004. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2498.10-2498.25"
  11005. }
  11006. },
  11007. "LOCK": {
  11008. "hide_name": 0,
  11009. "bits": [ 16 ],
  11010. "attributes": {
  11011. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2495.10-2495.14"
  11012. }
  11013. },
  11014. "PACKAGEPIN": {
  11015. "hide_name": 0,
  11016. "bits": [ 2 ],
  11017. "attributes": {
  11018. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2488.10-2488.20"
  11019. }
  11020. },
  11021. "PLLOUTCOREA": {
  11022. "hide_name": 0,
  11023. "bits": [ 3 ],
  11024. "attributes": {
  11025. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2489.10-2489.21"
  11026. }
  11027. },
  11028. "PLLOUTCOREB": {
  11029. "hide_name": 0,
  11030. "bits": [ 5 ],
  11031. "attributes": {
  11032. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2491.10-2491.21"
  11033. }
  11034. },
  11035. "PLLOUTGLOBALA": {
  11036. "hide_name": 0,
  11037. "bits": [ 4 ],
  11038. "attributes": {
  11039. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2490.10-2490.23"
  11040. }
  11041. },
  11042. "PLLOUTGLOBALB": {
  11043. "hide_name": 0,
  11044. "bits": [ 6 ],
  11045. "attributes": {
  11046. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2492.10-2492.23"
  11047. }
  11048. },
  11049. "RESETB": {
  11050. "hide_name": 0,
  11051. "bits": [ 18 ],
  11052. "attributes": {
  11053. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2497.10-2497.16"
  11054. }
  11055. },
  11056. "SCLK": {
  11057. "hide_name": 0,
  11058. "bits": [ 22 ],
  11059. "attributes": {
  11060. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2501.10-2501.14"
  11061. }
  11062. },
  11063. "SDI": {
  11064. "hide_name": 0,
  11065. "bits": [ 21 ],
  11066. "attributes": {
  11067. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2500.10-2500.13"
  11068. }
  11069. },
  11070. "SDO": {
  11071. "hide_name": 0,
  11072. "bits": [ 20 ],
  11073. "attributes": {
  11074. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2499.10-2499.13"
  11075. }
  11076. }
  11077. }
  11078. },
  11079. "SB_PLL40_CORE": {
  11080. "attributes": {
  11081. "blackbox": "00000000000000000000000000000001",
  11082. "cells_not_processed": "00000000000000000000000000000001",
  11083. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2425.1-2453.10"
  11084. },
  11085. "parameter_default_values": {
  11086. "DELAY_ADJUSTMENT_MODE_FEEDBACK": "FIXED",
  11087. "DELAY_ADJUSTMENT_MODE_RELATIVE": "FIXED",
  11088. "DIVF": "0000000",
  11089. "DIVQ": "000",
  11090. "DIVR": "0000",
  11091. "ENABLE_ICEGATE": "0",
  11092. "EXTERNAL_DIVIDE_FACTOR": "00000000000000000000000000000001",
  11093. "FDA_FEEDBACK": "0000",
  11094. "FDA_RELATIVE": "0000",
  11095. "FEEDBACK_PATH": "SIMPLE",
  11096. "FILTER_RANGE": "000",
  11097. "PLLOUT_SELECT": "GENCLK",
  11098. "SHIFTREG_DIV_MODE": "0",
  11099. "TEST_MODE": "0"
  11100. },
  11101. "ports": {
  11102. "REFERENCECLK": {
  11103. "direction": "input",
  11104. "bits": [ 2 ]
  11105. },
  11106. "PLLOUTCORE": {
  11107. "direction": "output",
  11108. "bits": [ 3 ]
  11109. },
  11110. "PLLOUTGLOBAL": {
  11111. "direction": "output",
  11112. "bits": [ 4 ]
  11113. },
  11114. "EXTFEEDBACK": {
  11115. "direction": "input",
  11116. "bits": [ 5 ]
  11117. },
  11118. "DYNAMICDELAY": {
  11119. "direction": "input",
  11120. "bits": [ 6, 7, 8, 9, 10, 11, 12, 13 ]
  11121. },
  11122. "LOCK": {
  11123. "direction": "output",
  11124. "bits": [ 14 ]
  11125. },
  11126. "BYPASS": {
  11127. "direction": "input",
  11128. "bits": [ 15 ]
  11129. },
  11130. "RESETB": {
  11131. "direction": "input",
  11132. "bits": [ 16 ]
  11133. },
  11134. "LATCHINPUTVALUE": {
  11135. "direction": "input",
  11136. "bits": [ 17 ]
  11137. },
  11138. "SDO": {
  11139. "direction": "output",
  11140. "bits": [ 18 ]
  11141. },
  11142. "SDI": {
  11143. "direction": "input",
  11144. "bits": [ 19 ]
  11145. },
  11146. "SCLK": {
  11147. "direction": "input",
  11148. "bits": [ 20 ]
  11149. }
  11150. },
  11151. "cells": {
  11152. },
  11153. "netnames": {
  11154. "BYPASS": {
  11155. "hide_name": 0,
  11156. "bits": [ 15 ],
  11157. "attributes": {
  11158. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2432.10-2432.16"
  11159. }
  11160. },
  11161. "DYNAMICDELAY": {
  11162. "hide_name": 0,
  11163. "bits": [ 6, 7, 8, 9, 10, 11, 12, 13 ],
  11164. "attributes": {
  11165. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2430.16-2430.28"
  11166. }
  11167. },
  11168. "EXTFEEDBACK": {
  11169. "hide_name": 0,
  11170. "bits": [ 5 ],
  11171. "attributes": {
  11172. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2429.10-2429.21"
  11173. }
  11174. },
  11175. "LATCHINPUTVALUE": {
  11176. "hide_name": 0,
  11177. "bits": [ 17 ],
  11178. "attributes": {
  11179. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2434.10-2434.25"
  11180. }
  11181. },
  11182. "LOCK": {
  11183. "hide_name": 0,
  11184. "bits": [ 14 ],
  11185. "attributes": {
  11186. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2431.10-2431.14"
  11187. }
  11188. },
  11189. "PLLOUTCORE": {
  11190. "hide_name": 0,
  11191. "bits": [ 3 ],
  11192. "attributes": {
  11193. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2427.10-2427.20"
  11194. }
  11195. },
  11196. "PLLOUTGLOBAL": {
  11197. "hide_name": 0,
  11198. "bits": [ 4 ],
  11199. "attributes": {
  11200. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2428.10-2428.22"
  11201. }
  11202. },
  11203. "REFERENCECLK": {
  11204. "hide_name": 0,
  11205. "bits": [ 2 ],
  11206. "attributes": {
  11207. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2426.10-2426.22"
  11208. }
  11209. },
  11210. "RESETB": {
  11211. "hide_name": 0,
  11212. "bits": [ 16 ],
  11213. "attributes": {
  11214. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2433.10-2433.16"
  11215. }
  11216. },
  11217. "SCLK": {
  11218. "hide_name": 0,
  11219. "bits": [ 20 ],
  11220. "attributes": {
  11221. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2437.10-2437.14"
  11222. }
  11223. },
  11224. "SDI": {
  11225. "hide_name": 0,
  11226. "bits": [ 19 ],
  11227. "attributes": {
  11228. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2436.10-2436.13"
  11229. }
  11230. },
  11231. "SDO": {
  11232. "hide_name": 0,
  11233. "bits": [ 18 ],
  11234. "attributes": {
  11235. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2435.10-2435.13"
  11236. }
  11237. }
  11238. }
  11239. },
  11240. "SB_PLL40_PAD": {
  11241. "attributes": {
  11242. "blackbox": "00000000000000000000000000000001",
  11243. "cells_not_processed": "00000000000000000000000000000001",
  11244. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2456.1-2484.10"
  11245. },
  11246. "parameter_default_values": {
  11247. "DELAY_ADJUSTMENT_MODE_FEEDBACK": "FIXED",
  11248. "DELAY_ADJUSTMENT_MODE_RELATIVE": "FIXED",
  11249. "DIVF": "0000000",
  11250. "DIVQ": "000",
  11251. "DIVR": "0000",
  11252. "ENABLE_ICEGATE": "0",
  11253. "EXTERNAL_DIVIDE_FACTOR": "00000000000000000000000000000001",
  11254. "FDA_FEEDBACK": "0000",
  11255. "FDA_RELATIVE": "0000",
  11256. "FEEDBACK_PATH": "SIMPLE",
  11257. "FILTER_RANGE": "000",
  11258. "PLLOUT_SELECT": "GENCLK",
  11259. "SHIFTREG_DIV_MODE": "0",
  11260. "TEST_MODE": "0"
  11261. },
  11262. "ports": {
  11263. "PACKAGEPIN": {
  11264. "direction": "input",
  11265. "bits": [ 2 ]
  11266. },
  11267. "PLLOUTCORE": {
  11268. "direction": "output",
  11269. "bits": [ 3 ]
  11270. },
  11271. "PLLOUTGLOBAL": {
  11272. "direction": "output",
  11273. "bits": [ 4 ]
  11274. },
  11275. "EXTFEEDBACK": {
  11276. "direction": "input",
  11277. "bits": [ 5 ]
  11278. },
  11279. "DYNAMICDELAY": {
  11280. "direction": "input",
  11281. "bits": [ 6, 7, 8, 9, 10, 11, 12, 13 ]
  11282. },
  11283. "LOCK": {
  11284. "direction": "output",
  11285. "bits": [ 14 ]
  11286. },
  11287. "BYPASS": {
  11288. "direction": "input",
  11289. "bits": [ 15 ]
  11290. },
  11291. "RESETB": {
  11292. "direction": "input",
  11293. "bits": [ 16 ]
  11294. },
  11295. "LATCHINPUTVALUE": {
  11296. "direction": "input",
  11297. "bits": [ 17 ]
  11298. },
  11299. "SDO": {
  11300. "direction": "output",
  11301. "bits": [ 18 ]
  11302. },
  11303. "SDI": {
  11304. "direction": "input",
  11305. "bits": [ 19 ]
  11306. },
  11307. "SCLK": {
  11308. "direction": "input",
  11309. "bits": [ 20 ]
  11310. }
  11311. },
  11312. "cells": {
  11313. },
  11314. "netnames": {
  11315. "BYPASS": {
  11316. "hide_name": 0,
  11317. "bits": [ 15 ],
  11318. "attributes": {
  11319. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2463.10-2463.16"
  11320. }
  11321. },
  11322. "DYNAMICDELAY": {
  11323. "hide_name": 0,
  11324. "bits": [ 6, 7, 8, 9, 10, 11, 12, 13 ],
  11325. "attributes": {
  11326. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2461.16-2461.28"
  11327. }
  11328. },
  11329. "EXTFEEDBACK": {
  11330. "hide_name": 0,
  11331. "bits": [ 5 ],
  11332. "attributes": {
  11333. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2460.10-2460.21"
  11334. }
  11335. },
  11336. "LATCHINPUTVALUE": {
  11337. "hide_name": 0,
  11338. "bits": [ 17 ],
  11339. "attributes": {
  11340. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2465.10-2465.25"
  11341. }
  11342. },
  11343. "LOCK": {
  11344. "hide_name": 0,
  11345. "bits": [ 14 ],
  11346. "attributes": {
  11347. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2462.10-2462.14"
  11348. }
  11349. },
  11350. "PACKAGEPIN": {
  11351. "hide_name": 0,
  11352. "bits": [ 2 ],
  11353. "attributes": {
  11354. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2457.10-2457.20"
  11355. }
  11356. },
  11357. "PLLOUTCORE": {
  11358. "hide_name": 0,
  11359. "bits": [ 3 ],
  11360. "attributes": {
  11361. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2458.10-2458.20"
  11362. }
  11363. },
  11364. "PLLOUTGLOBAL": {
  11365. "hide_name": 0,
  11366. "bits": [ 4 ],
  11367. "attributes": {
  11368. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2459.10-2459.22"
  11369. }
  11370. },
  11371. "RESETB": {
  11372. "hide_name": 0,
  11373. "bits": [ 16 ],
  11374. "attributes": {
  11375. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2464.10-2464.16"
  11376. }
  11377. },
  11378. "SCLK": {
  11379. "hide_name": 0,
  11380. "bits": [ 20 ],
  11381. "attributes": {
  11382. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2468.10-2468.14"
  11383. }
  11384. },
  11385. "SDI": {
  11386. "hide_name": 0,
  11387. "bits": [ 19 ],
  11388. "attributes": {
  11389. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2467.10-2467.13"
  11390. }
  11391. },
  11392. "SDO": {
  11393. "hide_name": 0,
  11394. "bits": [ 18 ],
  11395. "attributes": {
  11396. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2466.10-2466.13"
  11397. }
  11398. }
  11399. }
  11400. },
  11401. "SB_RAM40_4K": {
  11402. "attributes": {
  11403. "blackbox": "00000000000000000000000000000001",
  11404. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1487.1-1724.10"
  11405. },
  11406. "parameter_default_values": {
  11407. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11408. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11409. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11410. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11411. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11412. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11413. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11414. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11415. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11416. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11417. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11418. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11419. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11420. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11421. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11422. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  11423. "INIT_FILE": " ",
  11424. "READ_MODE": "00000000000000000000000000000000",
  11425. "WRITE_MODE": "00000000000000000000000000000000"
  11426. },
  11427. "ports": {
  11428. "RDATA": {
  11429. "direction": "output",
  11430. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  11431. },
  11432. "RCLK": {
  11433. "direction": "input",
  11434. "bits": [ 18 ]
  11435. },
  11436. "RCLKE": {
  11437. "direction": "input",
  11438. "bits": [ 19 ]
  11439. },
  11440. "RE": {
  11441. "direction": "input",
  11442. "bits": [ 20 ]
  11443. },
  11444. "RADDR": {
  11445. "direction": "input",
  11446. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  11447. },
  11448. "WCLK": {
  11449. "direction": "input",
  11450. "bits": [ 32 ]
  11451. },
  11452. "WCLKE": {
  11453. "direction": "input",
  11454. "bits": [ 33 ]
  11455. },
  11456. "WE": {
  11457. "direction": "input",
  11458. "bits": [ 34 ]
  11459. },
  11460. "WADDR": {
  11461. "direction": "input",
  11462. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  11463. },
  11464. "MASK": {
  11465. "direction": "input",
  11466. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  11467. },
  11468. "WDATA": {
  11469. "direction": "input",
  11470. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  11471. }
  11472. },
  11473. "cells": {
  11474. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$2795": {
  11475. "hide_name": 1,
  11476. "type": "$logic_and",
  11477. "parameters": {
  11478. "A_SIGNED": "00000000000000000000000000000000",
  11479. "A_WIDTH": "00000000000000000000000000000001",
  11480. "B_SIGNED": "00000000000000000000000000000000",
  11481. "B_WIDTH": "00000000000000000000000000000001",
  11482. "Y_WIDTH": "00000000000000000000000000000001"
  11483. },
  11484. "attributes": {
  11485. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  11486. },
  11487. "port_directions": {
  11488. "A": "input",
  11489. "B": "input",
  11490. "Y": "output"
  11491. },
  11492. "connections": {
  11493. "A": [ 34 ],
  11494. "B": [ 33 ],
  11495. "Y": [ 78 ]
  11496. }
  11497. },
  11498. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$2796": {
  11499. "hide_name": 1,
  11500. "type": "$logic_and",
  11501. "parameters": {
  11502. "A_SIGNED": "00000000000000000000000000000000",
  11503. "A_WIDTH": "00000000000000000000000000000001",
  11504. "B_SIGNED": "00000000000000000000000000000000",
  11505. "B_WIDTH": "00000000000000000000000000000001",
  11506. "Y_WIDTH": "00000000000000000000000000000001"
  11507. },
  11508. "attributes": {
  11509. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  11510. },
  11511. "port_directions": {
  11512. "A": "input",
  11513. "B": "input",
  11514. "Y": "output"
  11515. },
  11516. "connections": {
  11517. "A": [ 20 ],
  11518. "B": [ 19 ],
  11519. "Y": [ 79 ]
  11520. }
  11521. },
  11522. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$2797": {
  11523. "hide_name": 1,
  11524. "type": "$logic_and",
  11525. "parameters": {
  11526. "A_SIGNED": "00000000000000000000000000000000",
  11527. "A_WIDTH": "00000000000000000000000000000001",
  11528. "B_SIGNED": "00000000000000000000000000000000",
  11529. "B_WIDTH": "00000000000000000000000000000001",
  11530. "Y_WIDTH": "00000000000000000000000000000001"
  11531. },
  11532. "attributes": {
  11533. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  11534. },
  11535. "port_directions": {
  11536. "A": "input",
  11537. "B": "input",
  11538. "Y": "output"
  11539. },
  11540. "connections": {
  11541. "A": [ 34 ],
  11542. "B": [ 33 ],
  11543. "Y": [ 80 ]
  11544. }
  11545. },
  11546. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$2798": {
  11547. "hide_name": 1,
  11548. "type": "$logic_and",
  11549. "parameters": {
  11550. "A_SIGNED": "00000000000000000000000000000000",
  11551. "A_WIDTH": "00000000000000000000000000000001",
  11552. "B_SIGNED": "00000000000000000000000000000000",
  11553. "B_WIDTH": "00000000000000000000000000000001",
  11554. "Y_WIDTH": "00000000000000000000000000000001"
  11555. },
  11556. "attributes": {
  11557. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  11558. },
  11559. "port_directions": {
  11560. "A": "input",
  11561. "B": "input",
  11562. "Y": "output"
  11563. },
  11564. "connections": {
  11565. "A": [ 34 ],
  11566. "B": [ 33 ],
  11567. "Y": [ 81 ]
  11568. }
  11569. },
  11570. "$specify$2641": {
  11571. "hide_name": 1,
  11572. "type": "$specrule",
  11573. "parameters": {
  11574. "DST_PEN": "1",
  11575. "DST_POL": "1",
  11576. "DST_WIDTH": "00000000000000000000000000000001",
  11577. "SRC_PEN": "0",
  11578. "SRC_POL": "0",
  11579. "SRC_WIDTH": "00000000000000000000000000010000",
  11580. "TYPE": "$setup",
  11581. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11582. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11583. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11584. "T_LIMIT_MAX": "00000000000000000000001000000101",
  11585. "T_LIMIT_MIN": "00000000000000000000001000000101",
  11586. "T_LIMIT_TYP": "00000000000000000000001000000101"
  11587. },
  11588. "attributes": {
  11589. "module_not_derived": "00000000000000000000000000000001",
  11590. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.3-1705.51"
  11591. },
  11592. "port_directions": {
  11593. "DST": "input",
  11594. "DST_EN": "output",
  11595. "SRC": "input",
  11596. "SRC_EN": "output"
  11597. },
  11598. "connections": {
  11599. "DST": [ 32 ],
  11600. "DST_EN": [ 78 ],
  11601. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  11602. "SRC_EN": [ "1" ]
  11603. }
  11604. },
  11605. "$specify$2642": {
  11606. "hide_name": 1,
  11607. "type": "$specrule",
  11608. "parameters": {
  11609. "DST_PEN": "1",
  11610. "DST_POL": "1",
  11611. "DST_WIDTH": "00000000000000000000000000000001",
  11612. "SRC_PEN": "0",
  11613. "SRC_POL": "0",
  11614. "SRC_WIDTH": "00000000000000000000000000001011",
  11615. "TYPE": "$setup",
  11616. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11617. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11618. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11619. "T_LIMIT_MAX": "00000000000000000000000110000000",
  11620. "T_LIMIT_MIN": "00000000000000000000000110000000",
  11621. "T_LIMIT_TYP": "00000000000000000000000110000000"
  11622. },
  11623. "attributes": {
  11624. "module_not_derived": "00000000000000000000000000000001",
  11625. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.3-1707.52"
  11626. },
  11627. "port_directions": {
  11628. "DST": "input",
  11629. "DST_EN": "output",
  11630. "SRC": "input",
  11631. "SRC_EN": "output"
  11632. },
  11633. "connections": {
  11634. "DST": [ 18 ],
  11635. "DST_EN": [ 79 ],
  11636. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  11637. "SRC_EN": [ "1" ]
  11638. }
  11639. },
  11640. "$specify$2643": {
  11641. "hide_name": 1,
  11642. "type": "$specrule",
  11643. "parameters": {
  11644. "DST_PEN": "1",
  11645. "DST_POL": "1",
  11646. "DST_WIDTH": "00000000000000000000000000000001",
  11647. "SRC_PEN": "0",
  11648. "SRC_POL": "0",
  11649. "SRC_WIDTH": "00000000000000000000000000000001",
  11650. "TYPE": "$setup",
  11651. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11652. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11653. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11654. "T_LIMIT_MAX": "00000000000000000000000111110111",
  11655. "T_LIMIT_MIN": "00000000000000000000000111110111",
  11656. "T_LIMIT_TYP": "00000000000000000000000111110111"
  11657. },
  11658. "attributes": {
  11659. "module_not_derived": "00000000000000000000000000000001",
  11660. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1709.3-1709.36"
  11661. },
  11662. "port_directions": {
  11663. "DST": "input",
  11664. "DST_EN": "output",
  11665. "SRC": "input",
  11666. "SRC_EN": "output"
  11667. },
  11668. "connections": {
  11669. "DST": [ 18 ],
  11670. "DST_EN": [ "1" ],
  11671. "SRC": [ 19 ],
  11672. "SRC_EN": [ "1" ]
  11673. }
  11674. },
  11675. "$specify$2644": {
  11676. "hide_name": 1,
  11677. "type": "$specrule",
  11678. "parameters": {
  11679. "DST_PEN": "1",
  11680. "DST_POL": "1",
  11681. "DST_WIDTH": "00000000000000000000000000000001",
  11682. "SRC_PEN": "0",
  11683. "SRC_POL": "0",
  11684. "SRC_WIDTH": "00000000000000000000000000000001",
  11685. "TYPE": "$setup",
  11686. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11687. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11688. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11689. "T_LIMIT_MAX": "00000000000000000000000010111001",
  11690. "T_LIMIT_MIN": "00000000000000000000000010111001",
  11691. "T_LIMIT_TYP": "00000000000000000000000010111001"
  11692. },
  11693. "attributes": {
  11694. "module_not_derived": "00000000000000000000000000000001",
  11695. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1711.3-1711.33"
  11696. },
  11697. "port_directions": {
  11698. "DST": "input",
  11699. "DST_EN": "output",
  11700. "SRC": "input",
  11701. "SRC_EN": "output"
  11702. },
  11703. "connections": {
  11704. "DST": [ 18 ],
  11705. "DST_EN": [ "1" ],
  11706. "SRC": [ 20 ],
  11707. "SRC_EN": [ "1" ]
  11708. }
  11709. },
  11710. "$specify$2645": {
  11711. "hide_name": 1,
  11712. "type": "$specrule",
  11713. "parameters": {
  11714. "DST_PEN": "1",
  11715. "DST_POL": "1",
  11716. "DST_WIDTH": "00000000000000000000000000000001",
  11717. "SRC_PEN": "0",
  11718. "SRC_POL": "0",
  11719. "SRC_WIDTH": "00000000000000000000000000001011",
  11720. "TYPE": "$setup",
  11721. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11722. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11723. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11724. "T_LIMIT_MAX": "00000000000000000000000110101000",
  11725. "T_LIMIT_MIN": "00000000000000000000000110101000",
  11726. "T_LIMIT_TYP": "00000000000000000000000110101000"
  11727. },
  11728. "attributes": {
  11729. "module_not_derived": "00000000000000000000000000000001",
  11730. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.3-1713.52"
  11731. },
  11732. "port_directions": {
  11733. "DST": "input",
  11734. "DST_EN": "output",
  11735. "SRC": "input",
  11736. "SRC_EN": "output"
  11737. },
  11738. "connections": {
  11739. "DST": [ 32 ],
  11740. "DST_EN": [ 80 ],
  11741. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  11742. "SRC_EN": [ "1" ]
  11743. }
  11744. },
  11745. "$specify$2646": {
  11746. "hide_name": 1,
  11747. "type": "$specrule",
  11748. "parameters": {
  11749. "DST_PEN": "1",
  11750. "DST_POL": "1",
  11751. "DST_WIDTH": "00000000000000000000000000000001",
  11752. "SRC_PEN": "0",
  11753. "SRC_POL": "0",
  11754. "SRC_WIDTH": "00000000000000000000000000000001",
  11755. "TYPE": "$setup",
  11756. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11757. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11758. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11759. "T_LIMIT_MAX": "00000000000000000000000111110111",
  11760. "T_LIMIT_MIN": "00000000000000000000000111110111",
  11761. "T_LIMIT_TYP": "00000000000000000000000111110111"
  11762. },
  11763. "attributes": {
  11764. "module_not_derived": "00000000000000000000000000000001",
  11765. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1715.3-1715.36"
  11766. },
  11767. "port_directions": {
  11768. "DST": "input",
  11769. "DST_EN": "output",
  11770. "SRC": "input",
  11771. "SRC_EN": "output"
  11772. },
  11773. "connections": {
  11774. "DST": [ 32 ],
  11775. "DST_EN": [ "1" ],
  11776. "SRC": [ 33 ],
  11777. "SRC_EN": [ "1" ]
  11778. }
  11779. },
  11780. "$specify$2647": {
  11781. "hide_name": 1,
  11782. "type": "$specrule",
  11783. "parameters": {
  11784. "DST_PEN": "1",
  11785. "DST_POL": "1",
  11786. "DST_WIDTH": "00000000000000000000000000000001",
  11787. "SRC_PEN": "0",
  11788. "SRC_POL": "0",
  11789. "SRC_WIDTH": "00000000000000000000000000010000",
  11790. "TYPE": "$setup",
  11791. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11792. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11793. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11794. "T_LIMIT_MAX": "00000000000000000000000100110001",
  11795. "T_LIMIT_MIN": "00000000000000000000000100110001",
  11796. "T_LIMIT_TYP": "00000000000000000000000100110001"
  11797. },
  11798. "attributes": {
  11799. "module_not_derived": "00000000000000000000000000000001",
  11800. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.3-1717.52"
  11801. },
  11802. "port_directions": {
  11803. "DST": "input",
  11804. "DST_EN": "output",
  11805. "SRC": "input",
  11806. "SRC_EN": "output"
  11807. },
  11808. "connections": {
  11809. "DST": [ 32 ],
  11810. "DST_EN": [ 81 ],
  11811. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  11812. "SRC_EN": [ "1" ]
  11813. }
  11814. },
  11815. "$specify$2648": {
  11816. "hide_name": 1,
  11817. "type": "$specrule",
  11818. "parameters": {
  11819. "DST_PEN": "1",
  11820. "DST_POL": "1",
  11821. "DST_WIDTH": "00000000000000000000000000000001",
  11822. "SRC_PEN": "0",
  11823. "SRC_POL": "0",
  11824. "SRC_WIDTH": "00000000000000000000000000000001",
  11825. "TYPE": "$setup",
  11826. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  11827. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  11828. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  11829. "T_LIMIT_MAX": "00000000000000000000000011111100",
  11830. "T_LIMIT_MIN": "00000000000000000000000011111100",
  11831. "T_LIMIT_TYP": "00000000000000000000000011111100"
  11832. },
  11833. "attributes": {
  11834. "module_not_derived": "00000000000000000000000000000001",
  11835. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1719.3-1719.33"
  11836. },
  11837. "port_directions": {
  11838. "DST": "input",
  11839. "DST_EN": "output",
  11840. "SRC": "input",
  11841. "SRC_EN": "output"
  11842. },
  11843. "connections": {
  11844. "DST": [ 32 ],
  11845. "DST_EN": [ "1" ],
  11846. "SRC": [ 34 ],
  11847. "SRC_EN": [ "1" ]
  11848. }
  11849. },
  11850. "$specify$2649": {
  11851. "hide_name": 1,
  11852. "type": "$specify3",
  11853. "parameters": {
  11854. "DAT_DST_PEN": "0",
  11855. "DAT_DST_POL": "0",
  11856. "DST_WIDTH": "00000000000000000000000000010000",
  11857. "EDGE_EN": "1",
  11858. "EDGE_POL": "1",
  11859. "FULL": "1",
  11860. "SRC_DST_PEN": "0",
  11861. "SRC_DST_POL": "0",
  11862. "SRC_WIDTH": "00000000000000000000000000000001",
  11863. "T_FALL_MAX": "00000000000000000000010010011011",
  11864. "T_FALL_MIN": "00000000000000000000010010011011",
  11865. "T_FALL_TYP": "00000000000000000000010010011011",
  11866. "T_RISE_MAX": "00000000000000000000010010011011",
  11867. "T_RISE_MIN": "00000000000000000000010010011011",
  11868. "T_RISE_TYP": "00000000000000000000010010011011"
  11869. },
  11870. "attributes": {
  11871. "module_not_derived": "00000000000000000000000000000001",
  11872. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1721.3-1721.44"
  11873. },
  11874. "port_directions": {
  11875. "DAT": "input",
  11876. "DST": "input",
  11877. "EN": "input",
  11878. "SRC": "input"
  11879. },
  11880. "connections": {
  11881. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  11882. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  11883. "EN": [ "1" ],
  11884. "SRC": [ 18 ]
  11885. }
  11886. }
  11887. },
  11888. "netnames": {
  11889. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1705$2795_Y": {
  11890. "hide_name": 1,
  11891. "bits": [ 78 ],
  11892. "attributes": {
  11893. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1705.33-1705.44"
  11894. }
  11895. },
  11896. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1707$2796_Y": {
  11897. "hide_name": 1,
  11898. "bits": [ 79 ],
  11899. "attributes": {
  11900. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1707.34-1707.45"
  11901. }
  11902. },
  11903. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1713$2797_Y": {
  11904. "hide_name": 1,
  11905. "bits": [ 80 ],
  11906. "attributes": {
  11907. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1713.34-1713.45"
  11908. }
  11909. },
  11910. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1717$2798_Y": {
  11911. "hide_name": 1,
  11912. "bits": [ 81 ],
  11913. "attributes": {
  11914. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1717.34-1717.45"
  11915. }
  11916. },
  11917. "MASK": {
  11918. "hide_name": 0,
  11919. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  11920. "attributes": {
  11921. "defaultvalue": "0000000000000000",
  11922. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  11923. }
  11924. },
  11925. "RADDR": {
  11926. "hide_name": 0,
  11927. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  11928. "attributes": {
  11929. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1492.16-1492.21"
  11930. }
  11931. },
  11932. "RCLK": {
  11933. "hide_name": 0,
  11934. "bits": [ 18 ],
  11935. "attributes": {
  11936. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1489.16-1489.20"
  11937. }
  11938. },
  11939. "RCLKE": {
  11940. "hide_name": 0,
  11941. "bits": [ 19 ],
  11942. "attributes": {
  11943. "defaultvalue": "1",
  11944. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1490.16-1490.21"
  11945. }
  11946. },
  11947. "RDATA": {
  11948. "hide_name": 0,
  11949. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  11950. "attributes": {
  11951. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21"
  11952. }
  11953. },
  11954. "RE": {
  11955. "hide_name": 0,
  11956. "bits": [ 20 ],
  11957. "attributes": {
  11958. "defaultvalue": "0",
  11959. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1491.16-1491.18"
  11960. }
  11961. },
  11962. "WADDR": {
  11963. "hide_name": 0,
  11964. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  11965. "attributes": {
  11966. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1496.16-1496.21"
  11967. }
  11968. },
  11969. "WCLK": {
  11970. "hide_name": 0,
  11971. "bits": [ 32 ],
  11972. "attributes": {
  11973. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1493.16-1493.20"
  11974. }
  11975. },
  11976. "WCLKE": {
  11977. "hide_name": 0,
  11978. "bits": [ 33 ],
  11979. "attributes": {
  11980. "defaultvalue": "1",
  11981. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  11982. }
  11983. },
  11984. "WDATA": {
  11985. "hide_name": 0,
  11986. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  11987. "attributes": {
  11988. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1498.16-1498.21"
  11989. }
  11990. },
  11991. "WE": {
  11992. "hide_name": 0,
  11993. "bits": [ 34 ],
  11994. "attributes": {
  11995. "defaultvalue": "0",
  11996. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1495.16-1495.18"
  11997. }
  11998. }
  11999. }
  12000. },
  12001. "SB_RAM40_4KNR": {
  12002. "attributes": {
  12003. "blackbox": "00000000000000000000000000000001",
  12004. "cells_not_processed": "00000000000000000000000000000001",
  12005. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1726.1-1860.10"
  12006. },
  12007. "parameter_default_values": {
  12008. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12009. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12010. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12011. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12012. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12013. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12014. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12015. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12016. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12017. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12018. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12019. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12020. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12021. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12022. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12023. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12024. "INIT_FILE": " ",
  12025. "READ_MODE": "00000000000000000000000000000000",
  12026. "WRITE_MODE": "00000000000000000000000000000000"
  12027. },
  12028. "ports": {
  12029. "RDATA": {
  12030. "direction": "output",
  12031. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  12032. },
  12033. "RCLKN": {
  12034. "direction": "input",
  12035. "bits": [ 18 ]
  12036. },
  12037. "RCLKE": {
  12038. "direction": "input",
  12039. "bits": [ 19 ]
  12040. },
  12041. "RE": {
  12042. "direction": "input",
  12043. "bits": [ 20 ]
  12044. },
  12045. "RADDR": {
  12046. "direction": "input",
  12047. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  12048. },
  12049. "WCLK": {
  12050. "direction": "input",
  12051. "bits": [ 32 ]
  12052. },
  12053. "WCLKE": {
  12054. "direction": "input",
  12055. "bits": [ 33 ]
  12056. },
  12057. "WE": {
  12058. "direction": "input",
  12059. "bits": [ 34 ]
  12060. },
  12061. "WADDR": {
  12062. "direction": "input",
  12063. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  12064. },
  12065. "MASK": {
  12066. "direction": "input",
  12067. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  12068. },
  12069. "WDATA": {
  12070. "direction": "input",
  12071. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  12072. }
  12073. },
  12074. "cells": {
  12075. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1841$2799": {
  12076. "hide_name": 1,
  12077. "type": "$logic_and",
  12078. "parameters": {
  12079. "A_SIGNED": "00000000000000000000000000000000",
  12080. "A_WIDTH": "00000000000000000000000000000001",
  12081. "B_SIGNED": "00000000000000000000000000000000",
  12082. "B_WIDTH": "00000000000000000000000000000001",
  12083. "Y_WIDTH": "00000000000000000000000000000001"
  12084. },
  12085. "attributes": {
  12086. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1841.33-1841.44"
  12087. },
  12088. "port_directions": {
  12089. "A": "input",
  12090. "B": "input",
  12091. "Y": "output"
  12092. },
  12093. "connections": {
  12094. "A": [ 34 ],
  12095. "B": [ 33 ],
  12096. "Y": [ 78 ]
  12097. }
  12098. },
  12099. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1843$2800": {
  12100. "hide_name": 1,
  12101. "type": "$logic_and",
  12102. "parameters": {
  12103. "A_SIGNED": "00000000000000000000000000000000",
  12104. "A_WIDTH": "00000000000000000000000000000001",
  12105. "B_SIGNED": "00000000000000000000000000000000",
  12106. "B_WIDTH": "00000000000000000000000000000001",
  12107. "Y_WIDTH": "00000000000000000000000000000001"
  12108. },
  12109. "attributes": {
  12110. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1843.35-1843.46"
  12111. },
  12112. "port_directions": {
  12113. "A": "input",
  12114. "B": "input",
  12115. "Y": "output"
  12116. },
  12117. "connections": {
  12118. "A": [ 20 ],
  12119. "B": [ 19 ],
  12120. "Y": [ 79 ]
  12121. }
  12122. },
  12123. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1849$2801": {
  12124. "hide_name": 1,
  12125. "type": "$logic_and",
  12126. "parameters": {
  12127. "A_SIGNED": "00000000000000000000000000000000",
  12128. "A_WIDTH": "00000000000000000000000000000001",
  12129. "B_SIGNED": "00000000000000000000000000000000",
  12130. "B_WIDTH": "00000000000000000000000000000001",
  12131. "Y_WIDTH": "00000000000000000000000000000001"
  12132. },
  12133. "attributes": {
  12134. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1849.34-1849.45"
  12135. },
  12136. "port_directions": {
  12137. "A": "input",
  12138. "B": "input",
  12139. "Y": "output"
  12140. },
  12141. "connections": {
  12142. "A": [ 34 ],
  12143. "B": [ 33 ],
  12144. "Y": [ 80 ]
  12145. }
  12146. },
  12147. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1853$2802": {
  12148. "hide_name": 1,
  12149. "type": "$logic_and",
  12150. "parameters": {
  12151. "A_SIGNED": "00000000000000000000000000000000",
  12152. "A_WIDTH": "00000000000000000000000000000001",
  12153. "B_SIGNED": "00000000000000000000000000000000",
  12154. "B_WIDTH": "00000000000000000000000000000001",
  12155. "Y_WIDTH": "00000000000000000000000000000001"
  12156. },
  12157. "attributes": {
  12158. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1853.34-1853.45"
  12159. },
  12160. "port_directions": {
  12161. "A": "input",
  12162. "B": "input",
  12163. "Y": "output"
  12164. },
  12165. "connections": {
  12166. "A": [ 34 ],
  12167. "B": [ 33 ],
  12168. "Y": [ 81 ]
  12169. }
  12170. },
  12171. "$specify$2650": {
  12172. "hide_name": 1,
  12173. "type": "$specrule",
  12174. "parameters": {
  12175. "DST_PEN": "1",
  12176. "DST_POL": "1",
  12177. "DST_WIDTH": "00000000000000000000000000000001",
  12178. "SRC_PEN": "0",
  12179. "SRC_POL": "0",
  12180. "SRC_WIDTH": "00000000000000000000000000010000",
  12181. "TYPE": "$setup",
  12182. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12183. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12184. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12185. "T_LIMIT_MAX": "00000000000000000000001000000101",
  12186. "T_LIMIT_MIN": "00000000000000000000001000000101",
  12187. "T_LIMIT_TYP": "00000000000000000000001000000101"
  12188. },
  12189. "attributes": {
  12190. "module_not_derived": "00000000000000000000000000000001",
  12191. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1841.3-1841.51"
  12192. },
  12193. "port_directions": {
  12194. "DST": "input",
  12195. "DST_EN": "output",
  12196. "SRC": "input",
  12197. "SRC_EN": "output"
  12198. },
  12199. "connections": {
  12200. "DST": [ 32 ],
  12201. "DST_EN": [ 78 ],
  12202. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  12203. "SRC_EN": [ "1" ]
  12204. }
  12205. },
  12206. "$specify$2651": {
  12207. "hide_name": 1,
  12208. "type": "$specrule",
  12209. "parameters": {
  12210. "DST_PEN": "1",
  12211. "DST_POL": "1",
  12212. "DST_WIDTH": "00000000000000000000000000000001",
  12213. "SRC_PEN": "0",
  12214. "SRC_POL": "0",
  12215. "SRC_WIDTH": "00000000000000000000000000001011",
  12216. "TYPE": "$setup",
  12217. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12218. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12219. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12220. "T_LIMIT_MAX": "00000000000000000000000110000000",
  12221. "T_LIMIT_MIN": "00000000000000000000000110000000",
  12222. "T_LIMIT_TYP": "00000000000000000000000110000000"
  12223. },
  12224. "attributes": {
  12225. "module_not_derived": "00000000000000000000000000000001",
  12226. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1843.3-1843.53"
  12227. },
  12228. "port_directions": {
  12229. "DST": "input",
  12230. "DST_EN": "output",
  12231. "SRC": "input",
  12232. "SRC_EN": "output"
  12233. },
  12234. "connections": {
  12235. "DST": [ 18 ],
  12236. "DST_EN": [ 79 ],
  12237. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  12238. "SRC_EN": [ "1" ]
  12239. }
  12240. },
  12241. "$specify$2652": {
  12242. "hide_name": 1,
  12243. "type": "$specrule",
  12244. "parameters": {
  12245. "DST_PEN": "1",
  12246. "DST_POL": "1",
  12247. "DST_WIDTH": "00000000000000000000000000000001",
  12248. "SRC_PEN": "0",
  12249. "SRC_POL": "0",
  12250. "SRC_WIDTH": "00000000000000000000000000000001",
  12251. "TYPE": "$setup",
  12252. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12253. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12254. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12255. "T_LIMIT_MAX": "00000000000000000000000111110111",
  12256. "T_LIMIT_MIN": "00000000000000000000000111110111",
  12257. "T_LIMIT_TYP": "00000000000000000000000111110111"
  12258. },
  12259. "attributes": {
  12260. "module_not_derived": "00000000000000000000000000000001",
  12261. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1845.3-1845.37"
  12262. },
  12263. "port_directions": {
  12264. "DST": "input",
  12265. "DST_EN": "output",
  12266. "SRC": "input",
  12267. "SRC_EN": "output"
  12268. },
  12269. "connections": {
  12270. "DST": [ 18 ],
  12271. "DST_EN": [ "1" ],
  12272. "SRC": [ 19 ],
  12273. "SRC_EN": [ "1" ]
  12274. }
  12275. },
  12276. "$specify$2653": {
  12277. "hide_name": 1,
  12278. "type": "$specrule",
  12279. "parameters": {
  12280. "DST_PEN": "1",
  12281. "DST_POL": "1",
  12282. "DST_WIDTH": "00000000000000000000000000000001",
  12283. "SRC_PEN": "0",
  12284. "SRC_POL": "0",
  12285. "SRC_WIDTH": "00000000000000000000000000000001",
  12286. "TYPE": "$setup",
  12287. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12288. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12289. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12290. "T_LIMIT_MAX": "00000000000000000000000010111001",
  12291. "T_LIMIT_MIN": "00000000000000000000000010111001",
  12292. "T_LIMIT_TYP": "00000000000000000000000010111001"
  12293. },
  12294. "attributes": {
  12295. "module_not_derived": "00000000000000000000000000000001",
  12296. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1847.3-1847.34"
  12297. },
  12298. "port_directions": {
  12299. "DST": "input",
  12300. "DST_EN": "output",
  12301. "SRC": "input",
  12302. "SRC_EN": "output"
  12303. },
  12304. "connections": {
  12305. "DST": [ 18 ],
  12306. "DST_EN": [ "1" ],
  12307. "SRC": [ 20 ],
  12308. "SRC_EN": [ "1" ]
  12309. }
  12310. },
  12311. "$specify$2654": {
  12312. "hide_name": 1,
  12313. "type": "$specrule",
  12314. "parameters": {
  12315. "DST_PEN": "1",
  12316. "DST_POL": "1",
  12317. "DST_WIDTH": "00000000000000000000000000000001",
  12318. "SRC_PEN": "0",
  12319. "SRC_POL": "0",
  12320. "SRC_WIDTH": "00000000000000000000000000001011",
  12321. "TYPE": "$setup",
  12322. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12323. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12324. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12325. "T_LIMIT_MAX": "00000000000000000000000110101000",
  12326. "T_LIMIT_MIN": "00000000000000000000000110101000",
  12327. "T_LIMIT_TYP": "00000000000000000000000110101000"
  12328. },
  12329. "attributes": {
  12330. "module_not_derived": "00000000000000000000000000000001",
  12331. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1849.3-1849.52"
  12332. },
  12333. "port_directions": {
  12334. "DST": "input",
  12335. "DST_EN": "output",
  12336. "SRC": "input",
  12337. "SRC_EN": "output"
  12338. },
  12339. "connections": {
  12340. "DST": [ 32 ],
  12341. "DST_EN": [ 80 ],
  12342. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  12343. "SRC_EN": [ "1" ]
  12344. }
  12345. },
  12346. "$specify$2655": {
  12347. "hide_name": 1,
  12348. "type": "$specrule",
  12349. "parameters": {
  12350. "DST_PEN": "1",
  12351. "DST_POL": "1",
  12352. "DST_WIDTH": "00000000000000000000000000000001",
  12353. "SRC_PEN": "0",
  12354. "SRC_POL": "0",
  12355. "SRC_WIDTH": "00000000000000000000000000000001",
  12356. "TYPE": "$setup",
  12357. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12358. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12359. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12360. "T_LIMIT_MAX": "00000000000000000000000111110111",
  12361. "T_LIMIT_MIN": "00000000000000000000000111110111",
  12362. "T_LIMIT_TYP": "00000000000000000000000111110111"
  12363. },
  12364. "attributes": {
  12365. "module_not_derived": "00000000000000000000000000000001",
  12366. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1851.3-1851.36"
  12367. },
  12368. "port_directions": {
  12369. "DST": "input",
  12370. "DST_EN": "output",
  12371. "SRC": "input",
  12372. "SRC_EN": "output"
  12373. },
  12374. "connections": {
  12375. "DST": [ 32 ],
  12376. "DST_EN": [ "1" ],
  12377. "SRC": [ 33 ],
  12378. "SRC_EN": [ "1" ]
  12379. }
  12380. },
  12381. "$specify$2656": {
  12382. "hide_name": 1,
  12383. "type": "$specrule",
  12384. "parameters": {
  12385. "DST_PEN": "1",
  12386. "DST_POL": "1",
  12387. "DST_WIDTH": "00000000000000000000000000000001",
  12388. "SRC_PEN": "0",
  12389. "SRC_POL": "0",
  12390. "SRC_WIDTH": "00000000000000000000000000010000",
  12391. "TYPE": "$setup",
  12392. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12393. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12394. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12395. "T_LIMIT_MAX": "00000000000000000000000100110001",
  12396. "T_LIMIT_MIN": "00000000000000000000000100110001",
  12397. "T_LIMIT_TYP": "00000000000000000000000100110001"
  12398. },
  12399. "attributes": {
  12400. "module_not_derived": "00000000000000000000000000000001",
  12401. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1853.3-1853.52"
  12402. },
  12403. "port_directions": {
  12404. "DST": "input",
  12405. "DST_EN": "output",
  12406. "SRC": "input",
  12407. "SRC_EN": "output"
  12408. },
  12409. "connections": {
  12410. "DST": [ 32 ],
  12411. "DST_EN": [ 81 ],
  12412. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  12413. "SRC_EN": [ "1" ]
  12414. }
  12415. },
  12416. "$specify$2657": {
  12417. "hide_name": 1,
  12418. "type": "$specrule",
  12419. "parameters": {
  12420. "DST_PEN": "1",
  12421. "DST_POL": "1",
  12422. "DST_WIDTH": "00000000000000000000000000000001",
  12423. "SRC_PEN": "0",
  12424. "SRC_POL": "0",
  12425. "SRC_WIDTH": "00000000000000000000000000000001",
  12426. "TYPE": "$setup",
  12427. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12428. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12429. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12430. "T_LIMIT_MAX": "00000000000000000000000011111100",
  12431. "T_LIMIT_MIN": "00000000000000000000000011111100",
  12432. "T_LIMIT_TYP": "00000000000000000000000011111100"
  12433. },
  12434. "attributes": {
  12435. "module_not_derived": "00000000000000000000000000000001",
  12436. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1855.3-1855.33"
  12437. },
  12438. "port_directions": {
  12439. "DST": "input",
  12440. "DST_EN": "output",
  12441. "SRC": "input",
  12442. "SRC_EN": "output"
  12443. },
  12444. "connections": {
  12445. "DST": [ 32 ],
  12446. "DST_EN": [ "1" ],
  12447. "SRC": [ 34 ],
  12448. "SRC_EN": [ "1" ]
  12449. }
  12450. },
  12451. "$specify$2658": {
  12452. "hide_name": 1,
  12453. "type": "$specify3",
  12454. "parameters": {
  12455. "DAT_DST_PEN": "0",
  12456. "DAT_DST_POL": "0",
  12457. "DST_WIDTH": "00000000000000000000000000010000",
  12458. "EDGE_EN": "1",
  12459. "EDGE_POL": "1",
  12460. "FULL": "1",
  12461. "SRC_DST_PEN": "0",
  12462. "SRC_DST_POL": "0",
  12463. "SRC_WIDTH": "00000000000000000000000000000001",
  12464. "T_FALL_MAX": "00000000000000000000010010011011",
  12465. "T_FALL_MIN": "00000000000000000000010010011011",
  12466. "T_FALL_TYP": "00000000000000000000010010011011",
  12467. "T_RISE_MAX": "00000000000000000000010010011011",
  12468. "T_RISE_MIN": "00000000000000000000010010011011",
  12469. "T_RISE_TYP": "00000000000000000000010010011011"
  12470. },
  12471. "attributes": {
  12472. "module_not_derived": "00000000000000000000000000000001",
  12473. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1857.3-1857.45"
  12474. },
  12475. "port_directions": {
  12476. "DAT": "input",
  12477. "DST": "input",
  12478. "EN": "input",
  12479. "SRC": "input"
  12480. },
  12481. "connections": {
  12482. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  12483. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  12484. "EN": [ "1" ],
  12485. "SRC": [ 18 ]
  12486. }
  12487. }
  12488. },
  12489. "netnames": {
  12490. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1841$2799_Y": {
  12491. "hide_name": 1,
  12492. "bits": [ 78 ],
  12493. "attributes": {
  12494. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1841.33-1841.44"
  12495. }
  12496. },
  12497. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1843$2800_Y": {
  12498. "hide_name": 1,
  12499. "bits": [ 79 ],
  12500. "attributes": {
  12501. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1843.35-1843.46"
  12502. }
  12503. },
  12504. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1849$2801_Y": {
  12505. "hide_name": 1,
  12506. "bits": [ 80 ],
  12507. "attributes": {
  12508. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1849.34-1849.45"
  12509. }
  12510. },
  12511. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1853$2802_Y": {
  12512. "hide_name": 1,
  12513. "bits": [ 81 ],
  12514. "attributes": {
  12515. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1853.34-1853.45"
  12516. }
  12517. },
  12518. "MASK": {
  12519. "hide_name": 0,
  12520. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  12521. "attributes": {
  12522. "defaultvalue": "0000000000000000",
  12523. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1736.16-1736.20"
  12524. }
  12525. },
  12526. "RADDR": {
  12527. "hide_name": 0,
  12528. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  12529. "attributes": {
  12530. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1731.16-1731.21"
  12531. }
  12532. },
  12533. "RCLKE": {
  12534. "hide_name": 0,
  12535. "bits": [ 19 ],
  12536. "attributes": {
  12537. "defaultvalue": "1",
  12538. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1729.16-1729.21"
  12539. }
  12540. },
  12541. "RCLKN": {
  12542. "hide_name": 0,
  12543. "bits": [ 18 ],
  12544. "attributes": {
  12545. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1728.16-1728.21"
  12546. }
  12547. },
  12548. "RDATA": {
  12549. "hide_name": 0,
  12550. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  12551. "attributes": {
  12552. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1727.16-1727.21"
  12553. }
  12554. },
  12555. "RE": {
  12556. "hide_name": 0,
  12557. "bits": [ 20 ],
  12558. "attributes": {
  12559. "defaultvalue": "0",
  12560. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1730.16-1730.18"
  12561. }
  12562. },
  12563. "WADDR": {
  12564. "hide_name": 0,
  12565. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  12566. "attributes": {
  12567. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1735.16-1735.21"
  12568. }
  12569. },
  12570. "WCLK": {
  12571. "hide_name": 0,
  12572. "bits": [ 32 ],
  12573. "attributes": {
  12574. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1732.16-1732.20"
  12575. }
  12576. },
  12577. "WCLKE": {
  12578. "hide_name": 0,
  12579. "bits": [ 33 ],
  12580. "attributes": {
  12581. "defaultvalue": "1",
  12582. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1733.16-1733.21"
  12583. }
  12584. },
  12585. "WDATA": {
  12586. "hide_name": 0,
  12587. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  12588. "attributes": {
  12589. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1737.16-1737.21"
  12590. }
  12591. },
  12592. "WE": {
  12593. "hide_name": 0,
  12594. "bits": [ 34 ],
  12595. "attributes": {
  12596. "defaultvalue": "0",
  12597. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1734.16-1734.18"
  12598. }
  12599. }
  12600. }
  12601. },
  12602. "SB_RAM40_4KNRNW": {
  12603. "attributes": {
  12604. "blackbox": "00000000000000000000000000000001",
  12605. "cells_not_processed": "00000000000000000000000000000001",
  12606. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1998.1-2132.10"
  12607. },
  12608. "parameter_default_values": {
  12609. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12610. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12611. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12612. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12613. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12614. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12615. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12616. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12617. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12618. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12619. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12620. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12621. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12622. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12623. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12624. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  12625. "INIT_FILE": " ",
  12626. "READ_MODE": "00000000000000000000000000000000",
  12627. "WRITE_MODE": "00000000000000000000000000000000"
  12628. },
  12629. "ports": {
  12630. "RDATA": {
  12631. "direction": "output",
  12632. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  12633. },
  12634. "RCLKN": {
  12635. "direction": "input",
  12636. "bits": [ 18 ]
  12637. },
  12638. "RCLKE": {
  12639. "direction": "input",
  12640. "bits": [ 19 ]
  12641. },
  12642. "RE": {
  12643. "direction": "input",
  12644. "bits": [ 20 ]
  12645. },
  12646. "RADDR": {
  12647. "direction": "input",
  12648. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  12649. },
  12650. "WCLKN": {
  12651. "direction": "input",
  12652. "bits": [ 32 ]
  12653. },
  12654. "WCLKE": {
  12655. "direction": "input",
  12656. "bits": [ 33 ]
  12657. },
  12658. "WE": {
  12659. "direction": "input",
  12660. "bits": [ 34 ]
  12661. },
  12662. "WADDR": {
  12663. "direction": "input",
  12664. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  12665. },
  12666. "MASK": {
  12667. "direction": "input",
  12668. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  12669. },
  12670. "WDATA": {
  12671. "direction": "input",
  12672. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  12673. }
  12674. },
  12675. "cells": {
  12676. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2113$2807": {
  12677. "hide_name": 1,
  12678. "type": "$logic_and",
  12679. "parameters": {
  12680. "A_SIGNED": "00000000000000000000000000000000",
  12681. "A_WIDTH": "00000000000000000000000000000001",
  12682. "B_SIGNED": "00000000000000000000000000000000",
  12683. "B_WIDTH": "00000000000000000000000000000001",
  12684. "Y_WIDTH": "00000000000000000000000000000001"
  12685. },
  12686. "attributes": {
  12687. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2113.34-2113.45"
  12688. },
  12689. "port_directions": {
  12690. "A": "input",
  12691. "B": "input",
  12692. "Y": "output"
  12693. },
  12694. "connections": {
  12695. "A": [ 34 ],
  12696. "B": [ 33 ],
  12697. "Y": [ 78 ]
  12698. }
  12699. },
  12700. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2115$2808": {
  12701. "hide_name": 1,
  12702. "type": "$logic_and",
  12703. "parameters": {
  12704. "A_SIGNED": "00000000000000000000000000000000",
  12705. "A_WIDTH": "00000000000000000000000000000001",
  12706. "B_SIGNED": "00000000000000000000000000000000",
  12707. "B_WIDTH": "00000000000000000000000000000001",
  12708. "Y_WIDTH": "00000000000000000000000000000001"
  12709. },
  12710. "attributes": {
  12711. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2115.35-2115.46"
  12712. },
  12713. "port_directions": {
  12714. "A": "input",
  12715. "B": "input",
  12716. "Y": "output"
  12717. },
  12718. "connections": {
  12719. "A": [ 20 ],
  12720. "B": [ 19 ],
  12721. "Y": [ 79 ]
  12722. }
  12723. },
  12724. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2121$2809": {
  12725. "hide_name": 1,
  12726. "type": "$logic_and",
  12727. "parameters": {
  12728. "A_SIGNED": "00000000000000000000000000000000",
  12729. "A_WIDTH": "00000000000000000000000000000001",
  12730. "B_SIGNED": "00000000000000000000000000000000",
  12731. "B_WIDTH": "00000000000000000000000000000001",
  12732. "Y_WIDTH": "00000000000000000000000000000001"
  12733. },
  12734. "attributes": {
  12735. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2121.35-2121.46"
  12736. },
  12737. "port_directions": {
  12738. "A": "input",
  12739. "B": "input",
  12740. "Y": "output"
  12741. },
  12742. "connections": {
  12743. "A": [ 34 ],
  12744. "B": [ 33 ],
  12745. "Y": [ 80 ]
  12746. }
  12747. },
  12748. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2125$2810": {
  12749. "hide_name": 1,
  12750. "type": "$logic_and",
  12751. "parameters": {
  12752. "A_SIGNED": "00000000000000000000000000000000",
  12753. "A_WIDTH": "00000000000000000000000000000001",
  12754. "B_SIGNED": "00000000000000000000000000000000",
  12755. "B_WIDTH": "00000000000000000000000000000001",
  12756. "Y_WIDTH": "00000000000000000000000000000001"
  12757. },
  12758. "attributes": {
  12759. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2125.35-2125.46"
  12760. },
  12761. "port_directions": {
  12762. "A": "input",
  12763. "B": "input",
  12764. "Y": "output"
  12765. },
  12766. "connections": {
  12767. "A": [ 34 ],
  12768. "B": [ 33 ],
  12769. "Y": [ 81 ]
  12770. }
  12771. },
  12772. "$specify$2668": {
  12773. "hide_name": 1,
  12774. "type": "$specrule",
  12775. "parameters": {
  12776. "DST_PEN": "1",
  12777. "DST_POL": "1",
  12778. "DST_WIDTH": "00000000000000000000000000000001",
  12779. "SRC_PEN": "0",
  12780. "SRC_POL": "0",
  12781. "SRC_WIDTH": "00000000000000000000000000010000",
  12782. "TYPE": "$setup",
  12783. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12784. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12785. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12786. "T_LIMIT_MAX": "00000000000000000000001000000101",
  12787. "T_LIMIT_MIN": "00000000000000000000001000000101",
  12788. "T_LIMIT_TYP": "00000000000000000000001000000101"
  12789. },
  12790. "attributes": {
  12791. "module_not_derived": "00000000000000000000000000000001",
  12792. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2113.3-2113.52"
  12793. },
  12794. "port_directions": {
  12795. "DST": "input",
  12796. "DST_EN": "output",
  12797. "SRC": "input",
  12798. "SRC_EN": "output"
  12799. },
  12800. "connections": {
  12801. "DST": [ 32 ],
  12802. "DST_EN": [ 78 ],
  12803. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  12804. "SRC_EN": [ "1" ]
  12805. }
  12806. },
  12807. "$specify$2669": {
  12808. "hide_name": 1,
  12809. "type": "$specrule",
  12810. "parameters": {
  12811. "DST_PEN": "1",
  12812. "DST_POL": "1",
  12813. "DST_WIDTH": "00000000000000000000000000000001",
  12814. "SRC_PEN": "0",
  12815. "SRC_POL": "0",
  12816. "SRC_WIDTH": "00000000000000000000000000001011",
  12817. "TYPE": "$setup",
  12818. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12819. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12820. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12821. "T_LIMIT_MAX": "00000000000000000000000110000000",
  12822. "T_LIMIT_MIN": "00000000000000000000000110000000",
  12823. "T_LIMIT_TYP": "00000000000000000000000110000000"
  12824. },
  12825. "attributes": {
  12826. "module_not_derived": "00000000000000000000000000000001",
  12827. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2115.3-2115.53"
  12828. },
  12829. "port_directions": {
  12830. "DST": "input",
  12831. "DST_EN": "output",
  12832. "SRC": "input",
  12833. "SRC_EN": "output"
  12834. },
  12835. "connections": {
  12836. "DST": [ 18 ],
  12837. "DST_EN": [ 79 ],
  12838. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  12839. "SRC_EN": [ "1" ]
  12840. }
  12841. },
  12842. "$specify$2670": {
  12843. "hide_name": 1,
  12844. "type": "$specrule",
  12845. "parameters": {
  12846. "DST_PEN": "1",
  12847. "DST_POL": "1",
  12848. "DST_WIDTH": "00000000000000000000000000000001",
  12849. "SRC_PEN": "0",
  12850. "SRC_POL": "0",
  12851. "SRC_WIDTH": "00000000000000000000000000000001",
  12852. "TYPE": "$setup",
  12853. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12854. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12855. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12856. "T_LIMIT_MAX": "00000000000000000000000111110111",
  12857. "T_LIMIT_MIN": "00000000000000000000000111110111",
  12858. "T_LIMIT_TYP": "00000000000000000000000111110111"
  12859. },
  12860. "attributes": {
  12861. "module_not_derived": "00000000000000000000000000000001",
  12862. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2117.3-2117.37"
  12863. },
  12864. "port_directions": {
  12865. "DST": "input",
  12866. "DST_EN": "output",
  12867. "SRC": "input",
  12868. "SRC_EN": "output"
  12869. },
  12870. "connections": {
  12871. "DST": [ 18 ],
  12872. "DST_EN": [ "1" ],
  12873. "SRC": [ 19 ],
  12874. "SRC_EN": [ "1" ]
  12875. }
  12876. },
  12877. "$specify$2671": {
  12878. "hide_name": 1,
  12879. "type": "$specrule",
  12880. "parameters": {
  12881. "DST_PEN": "1",
  12882. "DST_POL": "1",
  12883. "DST_WIDTH": "00000000000000000000000000000001",
  12884. "SRC_PEN": "0",
  12885. "SRC_POL": "0",
  12886. "SRC_WIDTH": "00000000000000000000000000000001",
  12887. "TYPE": "$setup",
  12888. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12889. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12890. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12891. "T_LIMIT_MAX": "00000000000000000000000010111001",
  12892. "T_LIMIT_MIN": "00000000000000000000000010111001",
  12893. "T_LIMIT_TYP": "00000000000000000000000010111001"
  12894. },
  12895. "attributes": {
  12896. "module_not_derived": "00000000000000000000000000000001",
  12897. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2119.3-2119.34"
  12898. },
  12899. "port_directions": {
  12900. "DST": "input",
  12901. "DST_EN": "output",
  12902. "SRC": "input",
  12903. "SRC_EN": "output"
  12904. },
  12905. "connections": {
  12906. "DST": [ 18 ],
  12907. "DST_EN": [ "1" ],
  12908. "SRC": [ 20 ],
  12909. "SRC_EN": [ "1" ]
  12910. }
  12911. },
  12912. "$specify$2672": {
  12913. "hide_name": 1,
  12914. "type": "$specrule",
  12915. "parameters": {
  12916. "DST_PEN": "1",
  12917. "DST_POL": "1",
  12918. "DST_WIDTH": "00000000000000000000000000000001",
  12919. "SRC_PEN": "0",
  12920. "SRC_POL": "0",
  12921. "SRC_WIDTH": "00000000000000000000000000001011",
  12922. "TYPE": "$setup",
  12923. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12924. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12925. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12926. "T_LIMIT_MAX": "00000000000000000000000110101000",
  12927. "T_LIMIT_MIN": "00000000000000000000000110101000",
  12928. "T_LIMIT_TYP": "00000000000000000000000110101000"
  12929. },
  12930. "attributes": {
  12931. "module_not_derived": "00000000000000000000000000000001",
  12932. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2121.3-2121.53"
  12933. },
  12934. "port_directions": {
  12935. "DST": "input",
  12936. "DST_EN": "output",
  12937. "SRC": "input",
  12938. "SRC_EN": "output"
  12939. },
  12940. "connections": {
  12941. "DST": [ 32 ],
  12942. "DST_EN": [ 80 ],
  12943. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  12944. "SRC_EN": [ "1" ]
  12945. }
  12946. },
  12947. "$specify$2673": {
  12948. "hide_name": 1,
  12949. "type": "$specrule",
  12950. "parameters": {
  12951. "DST_PEN": "1",
  12952. "DST_POL": "1",
  12953. "DST_WIDTH": "00000000000000000000000000000001",
  12954. "SRC_PEN": "0",
  12955. "SRC_POL": "0",
  12956. "SRC_WIDTH": "00000000000000000000000000000001",
  12957. "TYPE": "$setup",
  12958. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12959. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12960. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12961. "T_LIMIT_MAX": "00000000000000000000000111110111",
  12962. "T_LIMIT_MIN": "00000000000000000000000111110111",
  12963. "T_LIMIT_TYP": "00000000000000000000000111110111"
  12964. },
  12965. "attributes": {
  12966. "module_not_derived": "00000000000000000000000000000001",
  12967. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2123.3-2123.37"
  12968. },
  12969. "port_directions": {
  12970. "DST": "input",
  12971. "DST_EN": "output",
  12972. "SRC": "input",
  12973. "SRC_EN": "output"
  12974. },
  12975. "connections": {
  12976. "DST": [ 32 ],
  12977. "DST_EN": [ "1" ],
  12978. "SRC": [ 33 ],
  12979. "SRC_EN": [ "1" ]
  12980. }
  12981. },
  12982. "$specify$2674": {
  12983. "hide_name": 1,
  12984. "type": "$specrule",
  12985. "parameters": {
  12986. "DST_PEN": "1",
  12987. "DST_POL": "1",
  12988. "DST_WIDTH": "00000000000000000000000000000001",
  12989. "SRC_PEN": "0",
  12990. "SRC_POL": "0",
  12991. "SRC_WIDTH": "00000000000000000000000000010000",
  12992. "TYPE": "$setup",
  12993. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  12994. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  12995. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  12996. "T_LIMIT_MAX": "00000000000000000000000100110001",
  12997. "T_LIMIT_MIN": "00000000000000000000000100110001",
  12998. "T_LIMIT_TYP": "00000000000000000000000100110001"
  12999. },
  13000. "attributes": {
  13001. "module_not_derived": "00000000000000000000000000000001",
  13002. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2125.3-2125.53"
  13003. },
  13004. "port_directions": {
  13005. "DST": "input",
  13006. "DST_EN": "output",
  13007. "SRC": "input",
  13008. "SRC_EN": "output"
  13009. },
  13010. "connections": {
  13011. "DST": [ 32 ],
  13012. "DST_EN": [ 81 ],
  13013. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  13014. "SRC_EN": [ "1" ]
  13015. }
  13016. },
  13017. "$specify$2675": {
  13018. "hide_name": 1,
  13019. "type": "$specrule",
  13020. "parameters": {
  13021. "DST_PEN": "1",
  13022. "DST_POL": "1",
  13023. "DST_WIDTH": "00000000000000000000000000000001",
  13024. "SRC_PEN": "0",
  13025. "SRC_POL": "0",
  13026. "SRC_WIDTH": "00000000000000000000000000000001",
  13027. "TYPE": "$setup",
  13028. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13029. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13030. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13031. "T_LIMIT_MAX": "00000000000000000000000011111100",
  13032. "T_LIMIT_MIN": "00000000000000000000000011111100",
  13033. "T_LIMIT_TYP": "00000000000000000000000011111100"
  13034. },
  13035. "attributes": {
  13036. "module_not_derived": "00000000000000000000000000000001",
  13037. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2127.3-2127.34"
  13038. },
  13039. "port_directions": {
  13040. "DST": "input",
  13041. "DST_EN": "output",
  13042. "SRC": "input",
  13043. "SRC_EN": "output"
  13044. },
  13045. "connections": {
  13046. "DST": [ 32 ],
  13047. "DST_EN": [ "1" ],
  13048. "SRC": [ 34 ],
  13049. "SRC_EN": [ "1" ]
  13050. }
  13051. },
  13052. "$specify$2676": {
  13053. "hide_name": 1,
  13054. "type": "$specify3",
  13055. "parameters": {
  13056. "DAT_DST_PEN": "0",
  13057. "DAT_DST_POL": "0",
  13058. "DST_WIDTH": "00000000000000000000000000010000",
  13059. "EDGE_EN": "1",
  13060. "EDGE_POL": "1",
  13061. "FULL": "1",
  13062. "SRC_DST_PEN": "0",
  13063. "SRC_DST_POL": "0",
  13064. "SRC_WIDTH": "00000000000000000000000000000001",
  13065. "T_FALL_MAX": "00000000000000000000010010011011",
  13066. "T_FALL_MIN": "00000000000000000000010010011011",
  13067. "T_FALL_TYP": "00000000000000000000010010011011",
  13068. "T_RISE_MAX": "00000000000000000000010010011011",
  13069. "T_RISE_MIN": "00000000000000000000010010011011",
  13070. "T_RISE_TYP": "00000000000000000000010010011011"
  13071. },
  13072. "attributes": {
  13073. "module_not_derived": "00000000000000000000000000000001",
  13074. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2129.3-2129.45"
  13075. },
  13076. "port_directions": {
  13077. "DAT": "input",
  13078. "DST": "input",
  13079. "EN": "input",
  13080. "SRC": "input"
  13081. },
  13082. "connections": {
  13083. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  13084. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  13085. "EN": [ "1" ],
  13086. "SRC": [ 18 ]
  13087. }
  13088. }
  13089. },
  13090. "netnames": {
  13091. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2113$2807_Y": {
  13092. "hide_name": 1,
  13093. "bits": [ 78 ],
  13094. "attributes": {
  13095. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2113.34-2113.45"
  13096. }
  13097. },
  13098. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2115$2808_Y": {
  13099. "hide_name": 1,
  13100. "bits": [ 79 ],
  13101. "attributes": {
  13102. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2115.35-2115.46"
  13103. }
  13104. },
  13105. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2121$2809_Y": {
  13106. "hide_name": 1,
  13107. "bits": [ 80 ],
  13108. "attributes": {
  13109. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2121.35-2121.46"
  13110. }
  13111. },
  13112. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:2125$2810_Y": {
  13113. "hide_name": 1,
  13114. "bits": [ 81 ],
  13115. "attributes": {
  13116. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2125.35-2125.46"
  13117. }
  13118. },
  13119. "MASK": {
  13120. "hide_name": 0,
  13121. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  13122. "attributes": {
  13123. "defaultvalue": "0000000000000000",
  13124. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2008.16-2008.20"
  13125. }
  13126. },
  13127. "RADDR": {
  13128. "hide_name": 0,
  13129. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  13130. "attributes": {
  13131. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2003.16-2003.21"
  13132. }
  13133. },
  13134. "RCLKE": {
  13135. "hide_name": 0,
  13136. "bits": [ 19 ],
  13137. "attributes": {
  13138. "defaultvalue": "1",
  13139. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2001.16-2001.21"
  13140. }
  13141. },
  13142. "RCLKN": {
  13143. "hide_name": 0,
  13144. "bits": [ 18 ],
  13145. "attributes": {
  13146. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2000.16-2000.21"
  13147. }
  13148. },
  13149. "RDATA": {
  13150. "hide_name": 0,
  13151. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  13152. "attributes": {
  13153. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1999.16-1999.21"
  13154. }
  13155. },
  13156. "RE": {
  13157. "hide_name": 0,
  13158. "bits": [ 20 ],
  13159. "attributes": {
  13160. "defaultvalue": "0",
  13161. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2002.16-2002.18"
  13162. }
  13163. },
  13164. "WADDR": {
  13165. "hide_name": 0,
  13166. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  13167. "attributes": {
  13168. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2007.16-2007.21"
  13169. }
  13170. },
  13171. "WCLKE": {
  13172. "hide_name": 0,
  13173. "bits": [ 33 ],
  13174. "attributes": {
  13175. "defaultvalue": "1",
  13176. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2005.16-2005.21"
  13177. }
  13178. },
  13179. "WCLKN": {
  13180. "hide_name": 0,
  13181. "bits": [ 32 ],
  13182. "attributes": {
  13183. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2004.16-2004.21"
  13184. }
  13185. },
  13186. "WDATA": {
  13187. "hide_name": 0,
  13188. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  13189. "attributes": {
  13190. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2009.16-2009.21"
  13191. }
  13192. },
  13193. "WE": {
  13194. "hide_name": 0,
  13195. "bits": [ 34 ],
  13196. "attributes": {
  13197. "defaultvalue": "0",
  13198. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2006.16-2006.18"
  13199. }
  13200. }
  13201. }
  13202. },
  13203. "SB_RAM40_4KNW": {
  13204. "attributes": {
  13205. "blackbox": "00000000000000000000000000000001",
  13206. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1862.1-1996.10"
  13207. },
  13208. "parameter_default_values": {
  13209. "INIT_0": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13210. "INIT_1": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13211. "INIT_2": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13212. "INIT_3": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13213. "INIT_4": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13214. "INIT_5": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13215. "INIT_6": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13216. "INIT_7": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13217. "INIT_8": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13218. "INIT_9": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13219. "INIT_A": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13220. "INIT_B": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13221. "INIT_C": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13222. "INIT_D": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13223. "INIT_E": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13224. "INIT_F": "0000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000000",
  13225. "INIT_FILE": " ",
  13226. "READ_MODE": "00000000000000000000000000000000",
  13227. "WRITE_MODE": "00000000000000000000000000000000"
  13228. },
  13229. "ports": {
  13230. "RDATA": {
  13231. "direction": "output",
  13232. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ]
  13233. },
  13234. "RCLK": {
  13235. "direction": "input",
  13236. "bits": [ 18 ]
  13237. },
  13238. "RCLKE": {
  13239. "direction": "input",
  13240. "bits": [ 19 ]
  13241. },
  13242. "RE": {
  13243. "direction": "input",
  13244. "bits": [ 20 ]
  13245. },
  13246. "RADDR": {
  13247. "direction": "input",
  13248. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  13249. },
  13250. "WCLKN": {
  13251. "direction": "input",
  13252. "bits": [ 32 ]
  13253. },
  13254. "WCLKE": {
  13255. "direction": "input",
  13256. "bits": [ 33 ]
  13257. },
  13258. "WE": {
  13259. "direction": "input",
  13260. "bits": [ 34 ]
  13261. },
  13262. "WADDR": {
  13263. "direction": "input",
  13264. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ]
  13265. },
  13266. "MASK": {
  13267. "direction": "input",
  13268. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ]
  13269. },
  13270. "WDATA": {
  13271. "direction": "input",
  13272. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ]
  13273. }
  13274. },
  13275. "cells": {
  13276. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1977$2803": {
  13277. "hide_name": 1,
  13278. "type": "$logic_and",
  13279. "parameters": {
  13280. "A_SIGNED": "00000000000000000000000000000000",
  13281. "A_WIDTH": "00000000000000000000000000000001",
  13282. "B_SIGNED": "00000000000000000000000000000000",
  13283. "B_WIDTH": "00000000000000000000000000000001",
  13284. "Y_WIDTH": "00000000000000000000000000000001"
  13285. },
  13286. "attributes": {
  13287. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1977.34-1977.45"
  13288. },
  13289. "port_directions": {
  13290. "A": "input",
  13291. "B": "input",
  13292. "Y": "output"
  13293. },
  13294. "connections": {
  13295. "A": [ 34 ],
  13296. "B": [ 33 ],
  13297. "Y": [ 78 ]
  13298. }
  13299. },
  13300. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1979$2804": {
  13301. "hide_name": 1,
  13302. "type": "$logic_and",
  13303. "parameters": {
  13304. "A_SIGNED": "00000000000000000000000000000000",
  13305. "A_WIDTH": "00000000000000000000000000000001",
  13306. "B_SIGNED": "00000000000000000000000000000000",
  13307. "B_WIDTH": "00000000000000000000000000000001",
  13308. "Y_WIDTH": "00000000000000000000000000000001"
  13309. },
  13310. "attributes": {
  13311. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1979.34-1979.45"
  13312. },
  13313. "port_directions": {
  13314. "A": "input",
  13315. "B": "input",
  13316. "Y": "output"
  13317. },
  13318. "connections": {
  13319. "A": [ 20 ],
  13320. "B": [ 19 ],
  13321. "Y": [ 79 ]
  13322. }
  13323. },
  13324. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1985$2805": {
  13325. "hide_name": 1,
  13326. "type": "$logic_and",
  13327. "parameters": {
  13328. "A_SIGNED": "00000000000000000000000000000000",
  13329. "A_WIDTH": "00000000000000000000000000000001",
  13330. "B_SIGNED": "00000000000000000000000000000000",
  13331. "B_WIDTH": "00000000000000000000000000000001",
  13332. "Y_WIDTH": "00000000000000000000000000000001"
  13333. },
  13334. "attributes": {
  13335. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1985.35-1985.46"
  13336. },
  13337. "port_directions": {
  13338. "A": "input",
  13339. "B": "input",
  13340. "Y": "output"
  13341. },
  13342. "connections": {
  13343. "A": [ 34 ],
  13344. "B": [ 33 ],
  13345. "Y": [ 80 ]
  13346. }
  13347. },
  13348. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1989$2806": {
  13349. "hide_name": 1,
  13350. "type": "$logic_and",
  13351. "parameters": {
  13352. "A_SIGNED": "00000000000000000000000000000000",
  13353. "A_WIDTH": "00000000000000000000000000000001",
  13354. "B_SIGNED": "00000000000000000000000000000000",
  13355. "B_WIDTH": "00000000000000000000000000000001",
  13356. "Y_WIDTH": "00000000000000000000000000000001"
  13357. },
  13358. "attributes": {
  13359. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1989.35-1989.46"
  13360. },
  13361. "port_directions": {
  13362. "A": "input",
  13363. "B": "input",
  13364. "Y": "output"
  13365. },
  13366. "connections": {
  13367. "A": [ 34 ],
  13368. "B": [ 33 ],
  13369. "Y": [ 81 ]
  13370. }
  13371. },
  13372. "$specify$2659": {
  13373. "hide_name": 1,
  13374. "type": "$specrule",
  13375. "parameters": {
  13376. "DST_PEN": "1",
  13377. "DST_POL": "1",
  13378. "DST_WIDTH": "00000000000000000000000000000001",
  13379. "SRC_PEN": "0",
  13380. "SRC_POL": "0",
  13381. "SRC_WIDTH": "00000000000000000000000000010000",
  13382. "TYPE": "$setup",
  13383. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13384. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13385. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13386. "T_LIMIT_MAX": "00000000000000000000001000000101",
  13387. "T_LIMIT_MIN": "00000000000000000000001000000101",
  13388. "T_LIMIT_TYP": "00000000000000000000001000000101"
  13389. },
  13390. "attributes": {
  13391. "module_not_derived": "00000000000000000000000000000001",
  13392. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1977.3-1977.52"
  13393. },
  13394. "port_directions": {
  13395. "DST": "input",
  13396. "DST_EN": "output",
  13397. "SRC": "input",
  13398. "SRC_EN": "output"
  13399. },
  13400. "connections": {
  13401. "DST": [ 32 ],
  13402. "DST_EN": [ 78 ],
  13403. "SRC": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  13404. "SRC_EN": [ "1" ]
  13405. }
  13406. },
  13407. "$specify$2660": {
  13408. "hide_name": 1,
  13409. "type": "$specrule",
  13410. "parameters": {
  13411. "DST_PEN": "1",
  13412. "DST_POL": "1",
  13413. "DST_WIDTH": "00000000000000000000000000000001",
  13414. "SRC_PEN": "0",
  13415. "SRC_POL": "0",
  13416. "SRC_WIDTH": "00000000000000000000000000001011",
  13417. "TYPE": "$setup",
  13418. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13419. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13420. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13421. "T_LIMIT_MAX": "00000000000000000000000110000000",
  13422. "T_LIMIT_MIN": "00000000000000000000000110000000",
  13423. "T_LIMIT_TYP": "00000000000000000000000110000000"
  13424. },
  13425. "attributes": {
  13426. "module_not_derived": "00000000000000000000000000000001",
  13427. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1979.3-1979.52"
  13428. },
  13429. "port_directions": {
  13430. "DST": "input",
  13431. "DST_EN": "output",
  13432. "SRC": "input",
  13433. "SRC_EN": "output"
  13434. },
  13435. "connections": {
  13436. "DST": [ 18 ],
  13437. "DST_EN": [ 79 ],
  13438. "SRC": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  13439. "SRC_EN": [ "1" ]
  13440. }
  13441. },
  13442. "$specify$2661": {
  13443. "hide_name": 1,
  13444. "type": "$specrule",
  13445. "parameters": {
  13446. "DST_PEN": "1",
  13447. "DST_POL": "1",
  13448. "DST_WIDTH": "00000000000000000000000000000001",
  13449. "SRC_PEN": "0",
  13450. "SRC_POL": "0",
  13451. "SRC_WIDTH": "00000000000000000000000000000001",
  13452. "TYPE": "$setup",
  13453. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13454. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13455. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13456. "T_LIMIT_MAX": "00000000000000000000000111110111",
  13457. "T_LIMIT_MIN": "00000000000000000000000111110111",
  13458. "T_LIMIT_TYP": "00000000000000000000000111110111"
  13459. },
  13460. "attributes": {
  13461. "module_not_derived": "00000000000000000000000000000001",
  13462. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1981.3-1981.36"
  13463. },
  13464. "port_directions": {
  13465. "DST": "input",
  13466. "DST_EN": "output",
  13467. "SRC": "input",
  13468. "SRC_EN": "output"
  13469. },
  13470. "connections": {
  13471. "DST": [ 18 ],
  13472. "DST_EN": [ "1" ],
  13473. "SRC": [ 19 ],
  13474. "SRC_EN": [ "1" ]
  13475. }
  13476. },
  13477. "$specify$2662": {
  13478. "hide_name": 1,
  13479. "type": "$specrule",
  13480. "parameters": {
  13481. "DST_PEN": "1",
  13482. "DST_POL": "1",
  13483. "DST_WIDTH": "00000000000000000000000000000001",
  13484. "SRC_PEN": "0",
  13485. "SRC_POL": "0",
  13486. "SRC_WIDTH": "00000000000000000000000000000001",
  13487. "TYPE": "$setup",
  13488. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13489. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13490. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13491. "T_LIMIT_MAX": "00000000000000000000000010111001",
  13492. "T_LIMIT_MIN": "00000000000000000000000010111001",
  13493. "T_LIMIT_TYP": "00000000000000000000000010111001"
  13494. },
  13495. "attributes": {
  13496. "module_not_derived": "00000000000000000000000000000001",
  13497. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1983.3-1983.33"
  13498. },
  13499. "port_directions": {
  13500. "DST": "input",
  13501. "DST_EN": "output",
  13502. "SRC": "input",
  13503. "SRC_EN": "output"
  13504. },
  13505. "connections": {
  13506. "DST": [ 18 ],
  13507. "DST_EN": [ "1" ],
  13508. "SRC": [ 20 ],
  13509. "SRC_EN": [ "1" ]
  13510. }
  13511. },
  13512. "$specify$2663": {
  13513. "hide_name": 1,
  13514. "type": "$specrule",
  13515. "parameters": {
  13516. "DST_PEN": "1",
  13517. "DST_POL": "1",
  13518. "DST_WIDTH": "00000000000000000000000000000001",
  13519. "SRC_PEN": "0",
  13520. "SRC_POL": "0",
  13521. "SRC_WIDTH": "00000000000000000000000000001011",
  13522. "TYPE": "$setup",
  13523. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13524. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13525. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13526. "T_LIMIT_MAX": "00000000000000000000000110101000",
  13527. "T_LIMIT_MIN": "00000000000000000000000110101000",
  13528. "T_LIMIT_TYP": "00000000000000000000000110101000"
  13529. },
  13530. "attributes": {
  13531. "module_not_derived": "00000000000000000000000000000001",
  13532. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1985.3-1985.53"
  13533. },
  13534. "port_directions": {
  13535. "DST": "input",
  13536. "DST_EN": "output",
  13537. "SRC": "input",
  13538. "SRC_EN": "output"
  13539. },
  13540. "connections": {
  13541. "DST": [ 32 ],
  13542. "DST_EN": [ 80 ],
  13543. "SRC": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  13544. "SRC_EN": [ "1" ]
  13545. }
  13546. },
  13547. "$specify$2664": {
  13548. "hide_name": 1,
  13549. "type": "$specrule",
  13550. "parameters": {
  13551. "DST_PEN": "1",
  13552. "DST_POL": "1",
  13553. "DST_WIDTH": "00000000000000000000000000000001",
  13554. "SRC_PEN": "0",
  13555. "SRC_POL": "0",
  13556. "SRC_WIDTH": "00000000000000000000000000000001",
  13557. "TYPE": "$setup",
  13558. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13559. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13560. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13561. "T_LIMIT_MAX": "00000000000000000000000111110111",
  13562. "T_LIMIT_MIN": "00000000000000000000000111110111",
  13563. "T_LIMIT_TYP": "00000000000000000000000111110111"
  13564. },
  13565. "attributes": {
  13566. "module_not_derived": "00000000000000000000000000000001",
  13567. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1987.3-1987.37"
  13568. },
  13569. "port_directions": {
  13570. "DST": "input",
  13571. "DST_EN": "output",
  13572. "SRC": "input",
  13573. "SRC_EN": "output"
  13574. },
  13575. "connections": {
  13576. "DST": [ 32 ],
  13577. "DST_EN": [ "1" ],
  13578. "SRC": [ 33 ],
  13579. "SRC_EN": [ "1" ]
  13580. }
  13581. },
  13582. "$specify$2665": {
  13583. "hide_name": 1,
  13584. "type": "$specrule",
  13585. "parameters": {
  13586. "DST_PEN": "1",
  13587. "DST_POL": "1",
  13588. "DST_WIDTH": "00000000000000000000000000000001",
  13589. "SRC_PEN": "0",
  13590. "SRC_POL": "0",
  13591. "SRC_WIDTH": "00000000000000000000000000010000",
  13592. "TYPE": "$setup",
  13593. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13594. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13595. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13596. "T_LIMIT_MAX": "00000000000000000000000100110001",
  13597. "T_LIMIT_MIN": "00000000000000000000000100110001",
  13598. "T_LIMIT_TYP": "00000000000000000000000100110001"
  13599. },
  13600. "attributes": {
  13601. "module_not_derived": "00000000000000000000000000000001",
  13602. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1989.3-1989.53"
  13603. },
  13604. "port_directions": {
  13605. "DST": "input",
  13606. "DST_EN": "output",
  13607. "SRC": "input",
  13608. "SRC_EN": "output"
  13609. },
  13610. "connections": {
  13611. "DST": [ 32 ],
  13612. "DST_EN": [ 81 ],
  13613. "SRC": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  13614. "SRC_EN": [ "1" ]
  13615. }
  13616. },
  13617. "$specify$2666": {
  13618. "hide_name": 1,
  13619. "type": "$specrule",
  13620. "parameters": {
  13621. "DST_PEN": "1",
  13622. "DST_POL": "1",
  13623. "DST_WIDTH": "00000000000000000000000000000001",
  13624. "SRC_PEN": "0",
  13625. "SRC_POL": "0",
  13626. "SRC_WIDTH": "00000000000000000000000000000001",
  13627. "TYPE": "$setup",
  13628. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  13629. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  13630. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  13631. "T_LIMIT_MAX": "00000000000000000000000011111100",
  13632. "T_LIMIT_MIN": "00000000000000000000000011111100",
  13633. "T_LIMIT_TYP": "00000000000000000000000011111100"
  13634. },
  13635. "attributes": {
  13636. "module_not_derived": "00000000000000000000000000000001",
  13637. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1991.3-1991.34"
  13638. },
  13639. "port_directions": {
  13640. "DST": "input",
  13641. "DST_EN": "output",
  13642. "SRC": "input",
  13643. "SRC_EN": "output"
  13644. },
  13645. "connections": {
  13646. "DST": [ 32 ],
  13647. "DST_EN": [ "1" ],
  13648. "SRC": [ 34 ],
  13649. "SRC_EN": [ "1" ]
  13650. }
  13651. },
  13652. "$specify$2667": {
  13653. "hide_name": 1,
  13654. "type": "$specify3",
  13655. "parameters": {
  13656. "DAT_DST_PEN": "0",
  13657. "DAT_DST_POL": "0",
  13658. "DST_WIDTH": "00000000000000000000000000010000",
  13659. "EDGE_EN": "1",
  13660. "EDGE_POL": "1",
  13661. "FULL": "1",
  13662. "SRC_DST_PEN": "0",
  13663. "SRC_DST_POL": "0",
  13664. "SRC_WIDTH": "00000000000000000000000000000001",
  13665. "T_FALL_MAX": "00000000000000000000010010011011",
  13666. "T_FALL_MIN": "00000000000000000000010010011011",
  13667. "T_FALL_TYP": "00000000000000000000010010011011",
  13668. "T_RISE_MAX": "00000000000000000000010010011011",
  13669. "T_RISE_MIN": "00000000000000000000010010011011",
  13670. "T_RISE_TYP": "00000000000000000000010010011011"
  13671. },
  13672. "attributes": {
  13673. "module_not_derived": "00000000000000000000000000000001",
  13674. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1993.3-1993.44"
  13675. },
  13676. "port_directions": {
  13677. "DAT": "input",
  13678. "DST": "input",
  13679. "EN": "input",
  13680. "SRC": "input"
  13681. },
  13682. "connections": {
  13683. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  13684. "DST": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  13685. "EN": [ "1" ],
  13686. "SRC": [ 18 ]
  13687. }
  13688. }
  13689. },
  13690. "netnames": {
  13691. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1977$2803_Y": {
  13692. "hide_name": 1,
  13693. "bits": [ 78 ],
  13694. "attributes": {
  13695. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1977.34-1977.45"
  13696. }
  13697. },
  13698. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1979$2804_Y": {
  13699. "hide_name": 1,
  13700. "bits": [ 79 ],
  13701. "attributes": {
  13702. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1979.34-1979.45"
  13703. }
  13704. },
  13705. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1985$2805_Y": {
  13706. "hide_name": 1,
  13707. "bits": [ 80 ],
  13708. "attributes": {
  13709. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1985.35-1985.46"
  13710. }
  13711. },
  13712. "$logic_and$/usr/bin/../share/yosys/ice40/cells_sim.v:1989$2806_Y": {
  13713. "hide_name": 1,
  13714. "bits": [ 81 ],
  13715. "attributes": {
  13716. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1989.35-1989.46"
  13717. }
  13718. },
  13719. "MASK": {
  13720. "hide_name": 0,
  13721. "bits": [ 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61 ],
  13722. "attributes": {
  13723. "defaultvalue": "0000000000000000",
  13724. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  13725. }
  13726. },
  13727. "RADDR": {
  13728. "hide_name": 0,
  13729. "bits": [ 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  13730. "attributes": {
  13731. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1867.16-1867.21"
  13732. }
  13733. },
  13734. "RCLK": {
  13735. "hide_name": 0,
  13736. "bits": [ 18 ],
  13737. "attributes": {
  13738. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1864.16-1864.20"
  13739. }
  13740. },
  13741. "RCLKE": {
  13742. "hide_name": 0,
  13743. "bits": [ 19 ],
  13744. "attributes": {
  13745. "defaultvalue": "1",
  13746. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1865.16-1865.21"
  13747. }
  13748. },
  13749. "RDATA": {
  13750. "hide_name": 0,
  13751. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17 ],
  13752. "attributes": {
  13753. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1863.16-1863.21"
  13754. }
  13755. },
  13756. "RE": {
  13757. "hide_name": 0,
  13758. "bits": [ 20 ],
  13759. "attributes": {
  13760. "defaultvalue": "0",
  13761. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1866.16-1866.18"
  13762. }
  13763. },
  13764. "WADDR": {
  13765. "hide_name": 0,
  13766. "bits": [ 35, 36, 37, 38, 39, 40, 41, 42, 43, 44, 45 ],
  13767. "attributes": {
  13768. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1871.16-1871.21"
  13769. }
  13770. },
  13771. "WCLKE": {
  13772. "hide_name": 0,
  13773. "bits": [ 33 ],
  13774. "attributes": {
  13775. "defaultvalue": "1",
  13776. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1869.16-1869.21"
  13777. }
  13778. },
  13779. "WCLKN": {
  13780. "hide_name": 0,
  13781. "bits": [ 32 ],
  13782. "attributes": {
  13783. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1868.16-1868.21"
  13784. }
  13785. },
  13786. "WDATA": {
  13787. "hide_name": 0,
  13788. "bits": [ 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77 ],
  13789. "attributes": {
  13790. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1873.16-1873.21"
  13791. }
  13792. },
  13793. "WE": {
  13794. "hide_name": 0,
  13795. "bits": [ 34 ],
  13796. "attributes": {
  13797. "defaultvalue": "0",
  13798. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:1870.16-1870.18"
  13799. }
  13800. }
  13801. }
  13802. },
  13803. "SB_RGBA_DRV": {
  13804. "attributes": {
  13805. "blackbox": "00000000000000000000000000000001",
  13806. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2692.1-2706.10"
  13807. },
  13808. "parameter_default_values": {
  13809. "CURRENT_MODE": "0b0",
  13810. "RGB0_CURRENT": "0b000000",
  13811. "RGB1_CURRENT": "0b000000",
  13812. "RGB2_CURRENT": "0b000000"
  13813. },
  13814. "ports": {
  13815. "CURREN": {
  13816. "direction": "input",
  13817. "bits": [ 2 ]
  13818. },
  13819. "RGBLEDEN": {
  13820. "direction": "input",
  13821. "bits": [ 3 ]
  13822. },
  13823. "RGB0PWM": {
  13824. "direction": "input",
  13825. "bits": [ 4 ]
  13826. },
  13827. "RGB1PWM": {
  13828. "direction": "input",
  13829. "bits": [ 5 ]
  13830. },
  13831. "RGB2PWM": {
  13832. "direction": "input",
  13833. "bits": [ 6 ]
  13834. },
  13835. "RGB0": {
  13836. "direction": "output",
  13837. "bits": [ 7 ]
  13838. },
  13839. "RGB1": {
  13840. "direction": "output",
  13841. "bits": [ 8 ]
  13842. },
  13843. "RGB2": {
  13844. "direction": "output",
  13845. "bits": [ 9 ]
  13846. }
  13847. },
  13848. "cells": {
  13849. },
  13850. "netnames": {
  13851. "CURREN": {
  13852. "hide_name": 0,
  13853. "bits": [ 2 ],
  13854. "attributes": {
  13855. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2693.8-2693.14"
  13856. }
  13857. },
  13858. "RGB0": {
  13859. "hide_name": 0,
  13860. "bits": [ 7 ],
  13861. "attributes": {
  13862. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2698.9-2698.13"
  13863. }
  13864. },
  13865. "RGB0PWM": {
  13866. "hide_name": 0,
  13867. "bits": [ 4 ],
  13868. "attributes": {
  13869. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2695.8-2695.15"
  13870. }
  13871. },
  13872. "RGB1": {
  13873. "hide_name": 0,
  13874. "bits": [ 8 ],
  13875. "attributes": {
  13876. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2699.9-2699.13"
  13877. }
  13878. },
  13879. "RGB1PWM": {
  13880. "hide_name": 0,
  13881. "bits": [ 5 ],
  13882. "attributes": {
  13883. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2696.8-2696.15"
  13884. }
  13885. },
  13886. "RGB2": {
  13887. "hide_name": 0,
  13888. "bits": [ 9 ],
  13889. "attributes": {
  13890. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2700.9-2700.13"
  13891. }
  13892. },
  13893. "RGB2PWM": {
  13894. "hide_name": 0,
  13895. "bits": [ 6 ],
  13896. "attributes": {
  13897. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2697.8-2697.15"
  13898. }
  13899. },
  13900. "RGBLEDEN": {
  13901. "hide_name": 0,
  13902. "bits": [ 3 ],
  13903. "attributes": {
  13904. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2694.8-2694.16"
  13905. }
  13906. }
  13907. }
  13908. },
  13909. "SB_RGB_DRV": {
  13910. "attributes": {
  13911. "blackbox": "00000000000000000000000000000001",
  13912. "cells_not_processed": "00000000000000000000000000000001",
  13913. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2716.1-2730.10"
  13914. },
  13915. "parameter_default_values": {
  13916. "CURRENT_MODE": "0b0",
  13917. "RGB0_CURRENT": "0b000000",
  13918. "RGB1_CURRENT": "0b000000",
  13919. "RGB2_CURRENT": "0b000000"
  13920. },
  13921. "ports": {
  13922. "RGBLEDEN": {
  13923. "direction": "input",
  13924. "bits": [ 2 ]
  13925. },
  13926. "RGB0PWM": {
  13927. "direction": "input",
  13928. "bits": [ 3 ]
  13929. },
  13930. "RGB1PWM": {
  13931. "direction": "input",
  13932. "bits": [ 4 ]
  13933. },
  13934. "RGB2PWM": {
  13935. "direction": "input",
  13936. "bits": [ 5 ]
  13937. },
  13938. "RGBPU": {
  13939. "direction": "input",
  13940. "bits": [ 6 ]
  13941. },
  13942. "RGB0": {
  13943. "direction": "output",
  13944. "bits": [ 7 ]
  13945. },
  13946. "RGB1": {
  13947. "direction": "output",
  13948. "bits": [ 8 ]
  13949. },
  13950. "RGB2": {
  13951. "direction": "output",
  13952. "bits": [ 9 ]
  13953. }
  13954. },
  13955. "cells": {
  13956. },
  13957. "netnames": {
  13958. "RGB0": {
  13959. "hide_name": 0,
  13960. "bits": [ 7 ],
  13961. "attributes": {
  13962. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2722.9-2722.13"
  13963. }
  13964. },
  13965. "RGB0PWM": {
  13966. "hide_name": 0,
  13967. "bits": [ 3 ],
  13968. "attributes": {
  13969. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2718.8-2718.15"
  13970. }
  13971. },
  13972. "RGB1": {
  13973. "hide_name": 0,
  13974. "bits": [ 8 ],
  13975. "attributes": {
  13976. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2723.9-2723.13"
  13977. }
  13978. },
  13979. "RGB1PWM": {
  13980. "hide_name": 0,
  13981. "bits": [ 4 ],
  13982. "attributes": {
  13983. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2719.8-2719.15"
  13984. }
  13985. },
  13986. "RGB2": {
  13987. "hide_name": 0,
  13988. "bits": [ 9 ],
  13989. "attributes": {
  13990. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2724.9-2724.13"
  13991. }
  13992. },
  13993. "RGB2PWM": {
  13994. "hide_name": 0,
  13995. "bits": [ 5 ],
  13996. "attributes": {
  13997. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2720.8-2720.15"
  13998. }
  13999. },
  14000. "RGBLEDEN": {
  14001. "hide_name": 0,
  14002. "bits": [ 2 ],
  14003. "attributes": {
  14004. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2717.8-2717.16"
  14005. }
  14006. },
  14007. "RGBPU": {
  14008. "hide_name": 0,
  14009. "bits": [ 6 ],
  14010. "attributes": {
  14011. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2721.8-2721.13"
  14012. }
  14013. }
  14014. }
  14015. },
  14016. "SB_SPI": {
  14017. "attributes": {
  14018. "blackbox": "00000000000000000000000000000001",
  14019. "cells_not_processed": "00000000000000000000000000000001",
  14020. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2776.1-2827.10"
  14021. },
  14022. "parameter_default_values": {
  14023. "BUS_ADDR74": "0b0000"
  14024. },
  14025. "ports": {
  14026. "SBCLKI": {
  14027. "direction": "input",
  14028. "bits": [ 2 ]
  14029. },
  14030. "SBRWI": {
  14031. "direction": "input",
  14032. "bits": [ 3 ]
  14033. },
  14034. "SBSTBI": {
  14035. "direction": "input",
  14036. "bits": [ 4 ]
  14037. },
  14038. "SBADRI7": {
  14039. "direction": "input",
  14040. "bits": [ 5 ]
  14041. },
  14042. "SBADRI6": {
  14043. "direction": "input",
  14044. "bits": [ 6 ]
  14045. },
  14046. "SBADRI5": {
  14047. "direction": "input",
  14048. "bits": [ 7 ]
  14049. },
  14050. "SBADRI4": {
  14051. "direction": "input",
  14052. "bits": [ 8 ]
  14053. },
  14054. "SBADRI3": {
  14055. "direction": "input",
  14056. "bits": [ 9 ]
  14057. },
  14058. "SBADRI2": {
  14059. "direction": "input",
  14060. "bits": [ 10 ]
  14061. },
  14062. "SBADRI1": {
  14063. "direction": "input",
  14064. "bits": [ 11 ]
  14065. },
  14066. "SBADRI0": {
  14067. "direction": "input",
  14068. "bits": [ 12 ]
  14069. },
  14070. "SBDATI7": {
  14071. "direction": "input",
  14072. "bits": [ 13 ]
  14073. },
  14074. "SBDATI6": {
  14075. "direction": "input",
  14076. "bits": [ 14 ]
  14077. },
  14078. "SBDATI5": {
  14079. "direction": "input",
  14080. "bits": [ 15 ]
  14081. },
  14082. "SBDATI4": {
  14083. "direction": "input",
  14084. "bits": [ 16 ]
  14085. },
  14086. "SBDATI3": {
  14087. "direction": "input",
  14088. "bits": [ 17 ]
  14089. },
  14090. "SBDATI2": {
  14091. "direction": "input",
  14092. "bits": [ 18 ]
  14093. },
  14094. "SBDATI1": {
  14095. "direction": "input",
  14096. "bits": [ 19 ]
  14097. },
  14098. "SBDATI0": {
  14099. "direction": "input",
  14100. "bits": [ 20 ]
  14101. },
  14102. "MI": {
  14103. "direction": "input",
  14104. "bits": [ 21 ]
  14105. },
  14106. "SI": {
  14107. "direction": "input",
  14108. "bits": [ 22 ]
  14109. },
  14110. "SCKI": {
  14111. "direction": "input",
  14112. "bits": [ 23 ]
  14113. },
  14114. "SCSNI": {
  14115. "direction": "input",
  14116. "bits": [ 24 ]
  14117. },
  14118. "SBDATO7": {
  14119. "direction": "output",
  14120. "bits": [ 25 ]
  14121. },
  14122. "SBDATO6": {
  14123. "direction": "output",
  14124. "bits": [ 26 ]
  14125. },
  14126. "SBDATO5": {
  14127. "direction": "output",
  14128. "bits": [ 27 ]
  14129. },
  14130. "SBDATO4": {
  14131. "direction": "output",
  14132. "bits": [ 28 ]
  14133. },
  14134. "SBDATO3": {
  14135. "direction": "output",
  14136. "bits": [ 29 ]
  14137. },
  14138. "SBDATO2": {
  14139. "direction": "output",
  14140. "bits": [ 30 ]
  14141. },
  14142. "SBDATO1": {
  14143. "direction": "output",
  14144. "bits": [ 31 ]
  14145. },
  14146. "SBDATO0": {
  14147. "direction": "output",
  14148. "bits": [ 32 ]
  14149. },
  14150. "SBACKO": {
  14151. "direction": "output",
  14152. "bits": [ 33 ]
  14153. },
  14154. "SPIIRQ": {
  14155. "direction": "output",
  14156. "bits": [ 34 ]
  14157. },
  14158. "SPIWKUP": {
  14159. "direction": "output",
  14160. "bits": [ 35 ]
  14161. },
  14162. "SO": {
  14163. "direction": "output",
  14164. "bits": [ 36 ]
  14165. },
  14166. "SOE": {
  14167. "direction": "output",
  14168. "bits": [ 37 ]
  14169. },
  14170. "MO": {
  14171. "direction": "output",
  14172. "bits": [ 38 ]
  14173. },
  14174. "MOE": {
  14175. "direction": "output",
  14176. "bits": [ 39 ]
  14177. },
  14178. "SCKO": {
  14179. "direction": "output",
  14180. "bits": [ 40 ]
  14181. },
  14182. "SCKOE": {
  14183. "direction": "output",
  14184. "bits": [ 41 ]
  14185. },
  14186. "MCSNO3": {
  14187. "direction": "output",
  14188. "bits": [ 42 ]
  14189. },
  14190. "MCSNO2": {
  14191. "direction": "output",
  14192. "bits": [ 43 ]
  14193. },
  14194. "MCSNO1": {
  14195. "direction": "output",
  14196. "bits": [ 44 ]
  14197. },
  14198. "MCSNO0": {
  14199. "direction": "output",
  14200. "bits": [ 45 ]
  14201. },
  14202. "MCSNOE3": {
  14203. "direction": "output",
  14204. "bits": [ 46 ]
  14205. },
  14206. "MCSNOE2": {
  14207. "direction": "output",
  14208. "bits": [ 47 ]
  14209. },
  14210. "MCSNOE1": {
  14211. "direction": "output",
  14212. "bits": [ 48 ]
  14213. },
  14214. "MCSNOE0": {
  14215. "direction": "output",
  14216. "bits": [ 49 ]
  14217. }
  14218. },
  14219. "cells": {
  14220. },
  14221. "netnames": {
  14222. "MCSNO0": {
  14223. "hide_name": 0,
  14224. "bits": [ 45 ],
  14225. "attributes": {
  14226. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2820.9-2820.15"
  14227. }
  14228. },
  14229. "MCSNO1": {
  14230. "hide_name": 0,
  14231. "bits": [ 44 ],
  14232. "attributes": {
  14233. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2819.9-2819.15"
  14234. }
  14235. },
  14236. "MCSNO2": {
  14237. "hide_name": 0,
  14238. "bits": [ 43 ],
  14239. "attributes": {
  14240. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2818.9-2818.15"
  14241. }
  14242. },
  14243. "MCSNO3": {
  14244. "hide_name": 0,
  14245. "bits": [ 42 ],
  14246. "attributes": {
  14247. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2817.9-2817.15"
  14248. }
  14249. },
  14250. "MCSNOE0": {
  14251. "hide_name": 0,
  14252. "bits": [ 49 ],
  14253. "attributes": {
  14254. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2824.9-2824.16"
  14255. }
  14256. },
  14257. "MCSNOE1": {
  14258. "hide_name": 0,
  14259. "bits": [ 48 ],
  14260. "attributes": {
  14261. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2823.9-2823.16"
  14262. }
  14263. },
  14264. "MCSNOE2": {
  14265. "hide_name": 0,
  14266. "bits": [ 47 ],
  14267. "attributes": {
  14268. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2822.9-2822.16"
  14269. }
  14270. },
  14271. "MCSNOE3": {
  14272. "hide_name": 0,
  14273. "bits": [ 46 ],
  14274. "attributes": {
  14275. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2821.9-2821.16"
  14276. }
  14277. },
  14278. "MI": {
  14279. "hide_name": 0,
  14280. "bits": [ 21 ],
  14281. "attributes": {
  14282. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2796.9-2796.11"
  14283. }
  14284. },
  14285. "MO": {
  14286. "hide_name": 0,
  14287. "bits": [ 38 ],
  14288. "attributes": {
  14289. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2813.9-2813.11"
  14290. }
  14291. },
  14292. "MOE": {
  14293. "hide_name": 0,
  14294. "bits": [ 39 ],
  14295. "attributes": {
  14296. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2814.9-2814.12"
  14297. }
  14298. },
  14299. "SBACKO": {
  14300. "hide_name": 0,
  14301. "bits": [ 33 ],
  14302. "attributes": {
  14303. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2808.9-2808.15"
  14304. }
  14305. },
  14306. "SBADRI0": {
  14307. "hide_name": 0,
  14308. "bits": [ 12 ],
  14309. "attributes": {
  14310. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2787.9-2787.16"
  14311. }
  14312. },
  14313. "SBADRI1": {
  14314. "hide_name": 0,
  14315. "bits": [ 11 ],
  14316. "attributes": {
  14317. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2786.9-2786.16"
  14318. }
  14319. },
  14320. "SBADRI2": {
  14321. "hide_name": 0,
  14322. "bits": [ 10 ],
  14323. "attributes": {
  14324. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2785.9-2785.16"
  14325. }
  14326. },
  14327. "SBADRI3": {
  14328. "hide_name": 0,
  14329. "bits": [ 9 ],
  14330. "attributes": {
  14331. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2784.9-2784.16"
  14332. }
  14333. },
  14334. "SBADRI4": {
  14335. "hide_name": 0,
  14336. "bits": [ 8 ],
  14337. "attributes": {
  14338. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2783.9-2783.16"
  14339. }
  14340. },
  14341. "SBADRI5": {
  14342. "hide_name": 0,
  14343. "bits": [ 7 ],
  14344. "attributes": {
  14345. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2782.9-2782.16"
  14346. }
  14347. },
  14348. "SBADRI6": {
  14349. "hide_name": 0,
  14350. "bits": [ 6 ],
  14351. "attributes": {
  14352. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2781.9-2781.16"
  14353. }
  14354. },
  14355. "SBADRI7": {
  14356. "hide_name": 0,
  14357. "bits": [ 5 ],
  14358. "attributes": {
  14359. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2780.9-2780.16"
  14360. }
  14361. },
  14362. "SBCLKI": {
  14363. "hide_name": 0,
  14364. "bits": [ 2 ],
  14365. "attributes": {
  14366. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2777.9-2777.15"
  14367. }
  14368. },
  14369. "SBDATI0": {
  14370. "hide_name": 0,
  14371. "bits": [ 20 ],
  14372. "attributes": {
  14373. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2795.9-2795.16"
  14374. }
  14375. },
  14376. "SBDATI1": {
  14377. "hide_name": 0,
  14378. "bits": [ 19 ],
  14379. "attributes": {
  14380. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2794.9-2794.16"
  14381. }
  14382. },
  14383. "SBDATI2": {
  14384. "hide_name": 0,
  14385. "bits": [ 18 ],
  14386. "attributes": {
  14387. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2793.9-2793.16"
  14388. }
  14389. },
  14390. "SBDATI3": {
  14391. "hide_name": 0,
  14392. "bits": [ 17 ],
  14393. "attributes": {
  14394. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2792.9-2792.16"
  14395. }
  14396. },
  14397. "SBDATI4": {
  14398. "hide_name": 0,
  14399. "bits": [ 16 ],
  14400. "attributes": {
  14401. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2791.9-2791.16"
  14402. }
  14403. },
  14404. "SBDATI5": {
  14405. "hide_name": 0,
  14406. "bits": [ 15 ],
  14407. "attributes": {
  14408. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2790.9-2790.16"
  14409. }
  14410. },
  14411. "SBDATI6": {
  14412. "hide_name": 0,
  14413. "bits": [ 14 ],
  14414. "attributes": {
  14415. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2789.9-2789.16"
  14416. }
  14417. },
  14418. "SBDATI7": {
  14419. "hide_name": 0,
  14420. "bits": [ 13 ],
  14421. "attributes": {
  14422. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2788.9-2788.16"
  14423. }
  14424. },
  14425. "SBDATO0": {
  14426. "hide_name": 0,
  14427. "bits": [ 32 ],
  14428. "attributes": {
  14429. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2807.9-2807.16"
  14430. }
  14431. },
  14432. "SBDATO1": {
  14433. "hide_name": 0,
  14434. "bits": [ 31 ],
  14435. "attributes": {
  14436. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2806.9-2806.16"
  14437. }
  14438. },
  14439. "SBDATO2": {
  14440. "hide_name": 0,
  14441. "bits": [ 30 ],
  14442. "attributes": {
  14443. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2805.9-2805.16"
  14444. }
  14445. },
  14446. "SBDATO3": {
  14447. "hide_name": 0,
  14448. "bits": [ 29 ],
  14449. "attributes": {
  14450. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2804.9-2804.16"
  14451. }
  14452. },
  14453. "SBDATO4": {
  14454. "hide_name": 0,
  14455. "bits": [ 28 ],
  14456. "attributes": {
  14457. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2803.9-2803.16"
  14458. }
  14459. },
  14460. "SBDATO5": {
  14461. "hide_name": 0,
  14462. "bits": [ 27 ],
  14463. "attributes": {
  14464. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2802.9-2802.16"
  14465. }
  14466. },
  14467. "SBDATO6": {
  14468. "hide_name": 0,
  14469. "bits": [ 26 ],
  14470. "attributes": {
  14471. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2801.9-2801.16"
  14472. }
  14473. },
  14474. "SBDATO7": {
  14475. "hide_name": 0,
  14476. "bits": [ 25 ],
  14477. "attributes": {
  14478. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2800.9-2800.16"
  14479. }
  14480. },
  14481. "SBRWI": {
  14482. "hide_name": 0,
  14483. "bits": [ 3 ],
  14484. "attributes": {
  14485. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2778.9-2778.14"
  14486. }
  14487. },
  14488. "SBSTBI": {
  14489. "hide_name": 0,
  14490. "bits": [ 4 ],
  14491. "attributes": {
  14492. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2779.9-2779.15"
  14493. }
  14494. },
  14495. "SCKI": {
  14496. "hide_name": 0,
  14497. "bits": [ 23 ],
  14498. "attributes": {
  14499. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2798.9-2798.13"
  14500. }
  14501. },
  14502. "SCKO": {
  14503. "hide_name": 0,
  14504. "bits": [ 40 ],
  14505. "attributes": {
  14506. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2815.9-2815.13"
  14507. }
  14508. },
  14509. "SCKOE": {
  14510. "hide_name": 0,
  14511. "bits": [ 41 ],
  14512. "attributes": {
  14513. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2816.9-2816.14"
  14514. }
  14515. },
  14516. "SCSNI": {
  14517. "hide_name": 0,
  14518. "bits": [ 24 ],
  14519. "attributes": {
  14520. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2799.9-2799.14"
  14521. }
  14522. },
  14523. "SI": {
  14524. "hide_name": 0,
  14525. "bits": [ 22 ],
  14526. "attributes": {
  14527. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2797.9-2797.11"
  14528. }
  14529. },
  14530. "SO": {
  14531. "hide_name": 0,
  14532. "bits": [ 36 ],
  14533. "attributes": {
  14534. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2811.9-2811.11"
  14535. }
  14536. },
  14537. "SOE": {
  14538. "hide_name": 0,
  14539. "bits": [ 37 ],
  14540. "attributes": {
  14541. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2812.9-2812.12"
  14542. }
  14543. },
  14544. "SPIIRQ": {
  14545. "hide_name": 0,
  14546. "bits": [ 34 ],
  14547. "attributes": {
  14548. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2809.9-2809.15"
  14549. }
  14550. },
  14551. "SPIWKUP": {
  14552. "hide_name": 0,
  14553. "bits": [ 35 ],
  14554. "attributes": {
  14555. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2810.9-2810.16"
  14556. }
  14557. }
  14558. }
  14559. },
  14560. "SB_SPRAM256KA": {
  14561. "attributes": {
  14562. "blackbox": "00000000000000000000000000000001",
  14563. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2600.1-2661.10"
  14564. },
  14565. "ports": {
  14566. "ADDRESS": {
  14567. "direction": "input",
  14568. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15 ]
  14569. },
  14570. "DATAIN": {
  14571. "direction": "input",
  14572. "bits": [ 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ]
  14573. },
  14574. "MASKWREN": {
  14575. "direction": "input",
  14576. "bits": [ 32, 33, 34, 35 ]
  14577. },
  14578. "WREN": {
  14579. "direction": "input",
  14580. "bits": [ 36 ]
  14581. },
  14582. "CHIPSELECT": {
  14583. "direction": "input",
  14584. "bits": [ 37 ]
  14585. },
  14586. "CLOCK": {
  14587. "direction": "input",
  14588. "bits": [ 38 ]
  14589. },
  14590. "STANDBY": {
  14591. "direction": "input",
  14592. "bits": [ 39 ]
  14593. },
  14594. "SLEEP": {
  14595. "direction": "input",
  14596. "bits": [ 40 ]
  14597. },
  14598. "POWEROFF": {
  14599. "direction": "input",
  14600. "bits": [ 41 ]
  14601. },
  14602. "DATAOUT": {
  14603. "direction": "output",
  14604. "bits": [ 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57 ]
  14605. }
  14606. },
  14607. "cells": {
  14608. "$specify$2712": {
  14609. "hide_name": 1,
  14610. "type": "$specrule",
  14611. "parameters": {
  14612. "DST_PEN": "1",
  14613. "DST_POL": "1",
  14614. "DST_WIDTH": "00000000000000000000000000000001",
  14615. "SRC_PEN": "1",
  14616. "SRC_POL": "1",
  14617. "SRC_WIDTH": "00000000000000000000000000001110",
  14618. "TYPE": "$setup",
  14619. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  14620. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  14621. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  14622. "T_LIMIT_MAX": "00000000000000000000000100001100",
  14623. "T_LIMIT_MIN": "00000000000000000000000100001100",
  14624. "T_LIMIT_TYP": "00000000000000000000000100001100"
  14625. },
  14626. "attributes": {
  14627. "module_not_derived": "00000000000000000000000000000001",
  14628. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2642.3-2642.47"
  14629. },
  14630. "port_directions": {
  14631. "DST": "input",
  14632. "DST_EN": "output",
  14633. "SRC": "input",
  14634. "SRC_EN": "output"
  14635. },
  14636. "connections": {
  14637. "DST": [ 38 ],
  14638. "DST_EN": [ "1" ],
  14639. "SRC": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15 ],
  14640. "SRC_EN": [ "1" ]
  14641. }
  14642. },
  14643. "$specify$2713": {
  14644. "hide_name": 1,
  14645. "type": "$specrule",
  14646. "parameters": {
  14647. "DST_PEN": "1",
  14648. "DST_POL": "1",
  14649. "DST_WIDTH": "00000000000000000000000000000001",
  14650. "SRC_PEN": "0",
  14651. "SRC_POL": "0",
  14652. "SRC_WIDTH": "00000000000000000000000000000001",
  14653. "TYPE": "$setup",
  14654. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  14655. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  14656. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  14657. "T_LIMIT_MAX": "00000000000000000000000110010100",
  14658. "T_LIMIT_MIN": "00000000000000000000000110010100",
  14659. "T_LIMIT_TYP": "00000000000000000000000110010100"
  14660. },
  14661. "attributes": {
  14662. "module_not_derived": "00000000000000000000000000000001",
  14663. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2644.3-2644.42"
  14664. },
  14665. "port_directions": {
  14666. "DST": "input",
  14667. "DST_EN": "output",
  14668. "SRC": "input",
  14669. "SRC_EN": "output"
  14670. },
  14671. "connections": {
  14672. "DST": [ 38 ],
  14673. "DST_EN": [ "1" ],
  14674. "SRC": [ 37 ],
  14675. "SRC_EN": [ "1" ]
  14676. }
  14677. },
  14678. "$specify$2714": {
  14679. "hide_name": 1,
  14680. "type": "$specrule",
  14681. "parameters": {
  14682. "DST_PEN": "1",
  14683. "DST_POL": "1",
  14684. "DST_WIDTH": "00000000000000000000000000000001",
  14685. "SRC_PEN": "0",
  14686. "SRC_POL": "0",
  14687. "SRC_WIDTH": "00000000000000000000000000010000",
  14688. "TYPE": "$setup",
  14689. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  14690. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  14691. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  14692. "T_LIMIT_MAX": "00000000000000000000000010001111",
  14693. "T_LIMIT_MIN": "00000000000000000000000010001111",
  14694. "T_LIMIT_TYP": "00000000000000000000000010001111"
  14695. },
  14696. "attributes": {
  14697. "module_not_derived": "00000000000000000000000000000001",
  14698. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2646.3-2646.38"
  14699. },
  14700. "port_directions": {
  14701. "DST": "input",
  14702. "DST_EN": "output",
  14703. "SRC": "input",
  14704. "SRC_EN": "output"
  14705. },
  14706. "connections": {
  14707. "DST": [ 38 ],
  14708. "DST_EN": [ "1" ],
  14709. "SRC": [ 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  14710. "SRC_EN": [ "1" ]
  14711. }
  14712. },
  14713. "$specify$2715": {
  14714. "hide_name": 1,
  14715. "type": "$specrule",
  14716. "parameters": {
  14717. "DST_PEN": "1",
  14718. "DST_POL": "1",
  14719. "DST_WIDTH": "00000000000000000000000000000001",
  14720. "SRC_PEN": "0",
  14721. "SRC_POL": "0",
  14722. "SRC_WIDTH": "00000000000000000000000000000100",
  14723. "TYPE": "$setup",
  14724. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  14725. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  14726. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  14727. "T_LIMIT_MAX": "00000000000000000000000010001111",
  14728. "T_LIMIT_MIN": "00000000000000000000000010001111",
  14729. "T_LIMIT_TYP": "00000000000000000000000010001111"
  14730. },
  14731. "attributes": {
  14732. "module_not_derived": "00000000000000000000000000000001",
  14733. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2648.3-2648.40"
  14734. },
  14735. "port_directions": {
  14736. "DST": "input",
  14737. "DST_EN": "output",
  14738. "SRC": "input",
  14739. "SRC_EN": "output"
  14740. },
  14741. "connections": {
  14742. "DST": [ 38 ],
  14743. "DST_EN": [ "1" ],
  14744. "SRC": [ 32, 33, 34, 35 ],
  14745. "SRC_EN": [ "1" ]
  14746. }
  14747. },
  14748. "$specify$2716": {
  14749. "hide_name": 1,
  14750. "type": "$specrule",
  14751. "parameters": {
  14752. "DST_PEN": "1",
  14753. "DST_POL": "1",
  14754. "DST_WIDTH": "00000000000000000000000000000001",
  14755. "SRC_PEN": "0",
  14756. "SRC_POL": "0",
  14757. "SRC_WIDTH": "00000000000000000000000000000001",
  14758. "TYPE": "$setup",
  14759. "T_LIMIT2_MAX": "00000000000000000000000000000000",
  14760. "T_LIMIT2_MIN": "00000000000000000000000000000000",
  14761. "T_LIMIT2_TYP": "00000000000000000000000000000000",
  14762. "T_LIMIT_MAX": "00000000000000000000000100100001",
  14763. "T_LIMIT_MIN": "00000000000000000000000100100001",
  14764. "T_LIMIT_TYP": "00000000000000000000000100100001"
  14765. },
  14766. "attributes": {
  14767. "module_not_derived": "00000000000000000000000000000001",
  14768. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2654.3-2654.36"
  14769. },
  14770. "port_directions": {
  14771. "DST": "input",
  14772. "DST_EN": "output",
  14773. "SRC": "input",
  14774. "SRC_EN": "output"
  14775. },
  14776. "connections": {
  14777. "DST": [ 38 ],
  14778. "DST_EN": [ "1" ],
  14779. "SRC": [ 36 ],
  14780. "SRC_EN": [ "1" ]
  14781. }
  14782. },
  14783. "$specify$2717": {
  14784. "hide_name": 1,
  14785. "type": "$specify3",
  14786. "parameters": {
  14787. "DAT_DST_PEN": "0",
  14788. "DAT_DST_POL": "0",
  14789. "DST_WIDTH": "00000000000000000000000000010000",
  14790. "EDGE_EN": "1",
  14791. "EDGE_POL": "1",
  14792. "FULL": "1",
  14793. "SRC_DST_PEN": "0",
  14794. "SRC_DST_POL": "0",
  14795. "SRC_WIDTH": "00000000000000000000000000000001",
  14796. "T_FALL_MAX": "00000000000000000000011100011101",
  14797. "T_FALL_MIN": "00000000000000000000011100011101",
  14798. "T_FALL_TYP": "00000000000000000000011100011101",
  14799. "T_RISE_MAX": "00000000000000000000011100011101",
  14800. "T_RISE_MIN": "00000000000000000000011100011101",
  14801. "T_RISE_TYP": "00000000000000000000011100011101"
  14802. },
  14803. "attributes": {
  14804. "module_not_derived": "00000000000000000000000000000001",
  14805. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2656.3-2656.47"
  14806. },
  14807. "port_directions": {
  14808. "DAT": "input",
  14809. "DST": "input",
  14810. "EN": "input",
  14811. "SRC": "input"
  14812. },
  14813. "connections": {
  14814. "DAT": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  14815. "DST": [ 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57 ],
  14816. "EN": [ "1" ],
  14817. "SRC": [ 38 ]
  14818. }
  14819. },
  14820. "$specify$2718": {
  14821. "hide_name": 1,
  14822. "type": "$specify3",
  14823. "parameters": {
  14824. "DAT_DST_PEN": "0",
  14825. "DAT_DST_POL": "0",
  14826. "DST_WIDTH": "00000000000000000000000000010000",
  14827. "EDGE_EN": "1",
  14828. "EDGE_POL": "1",
  14829. "FULL": "1",
  14830. "SRC_DST_PEN": "0",
  14831. "SRC_DST_POL": "0",
  14832. "SRC_WIDTH": "00000000000000000000000000000001",
  14833. "T_FALL_MAX": "00000000000000000000010001001011",
  14834. "T_FALL_MIN": "00000000000000000000010001001011",
  14835. "T_FALL_TYP": "00000000000000000000010001001011",
  14836. "T_RISE_MAX": "00000000000000000000010001001011",
  14837. "T_RISE_MIN": "00000000000000000000010001001011",
  14838. "T_RISE_TYP": "00000000000000000000010001001011"
  14839. },
  14840. "attributes": {
  14841. "module_not_derived": "00000000000000000000000000000001",
  14842. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2658.3-2658.47"
  14843. },
  14844. "port_directions": {
  14845. "DAT": "input",
  14846. "DST": "input",
  14847. "EN": "input",
  14848. "SRC": "input"
  14849. },
  14850. "connections": {
  14851. "DAT": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  14852. "DST": [ 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57 ],
  14853. "EN": [ "1" ],
  14854. "SRC": [ 40 ]
  14855. }
  14856. }
  14857. },
  14858. "netnames": {
  14859. "ADDRESS": {
  14860. "hide_name": 0,
  14861. "bits": [ 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15 ],
  14862. "attributes": {
  14863. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2601.15-2601.22"
  14864. }
  14865. },
  14866. "CHIPSELECT": {
  14867. "hide_name": 0,
  14868. "bits": [ 37 ],
  14869. "attributes": {
  14870. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2604.14-2604.24"
  14871. }
  14872. },
  14873. "CLOCK": {
  14874. "hide_name": 0,
  14875. "bits": [ 38 ],
  14876. "attributes": {
  14877. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2604.26-2604.31"
  14878. }
  14879. },
  14880. "DATAIN": {
  14881. "hide_name": 0,
  14882. "bits": [ 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31 ],
  14883. "attributes": {
  14884. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2602.15-2602.21"
  14885. }
  14886. },
  14887. "DATAOUT": {
  14888. "hide_name": 0,
  14889. "bits": [ 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57 ],
  14890. "attributes": {
  14891. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2605.20-2605.27"
  14892. }
  14893. },
  14894. "MASKWREN": {
  14895. "hide_name": 0,
  14896. "bits": [ 32, 33, 34, 35 ],
  14897. "attributes": {
  14898. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2603.14-2603.22"
  14899. }
  14900. },
  14901. "POWEROFF": {
  14902. "hide_name": 0,
  14903. "bits": [ 41 ],
  14904. "attributes": {
  14905. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2604.49-2604.57"
  14906. }
  14907. },
  14908. "SLEEP": {
  14909. "hide_name": 0,
  14910. "bits": [ 40 ],
  14911. "attributes": {
  14912. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2604.42-2604.47"
  14913. }
  14914. },
  14915. "STANDBY": {
  14916. "hide_name": 0,
  14917. "bits": [ 39 ],
  14918. "attributes": {
  14919. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2604.33-2604.40"
  14920. }
  14921. },
  14922. "WREN": {
  14923. "hide_name": 0,
  14924. "bits": [ 36 ],
  14925. "attributes": {
  14926. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2604.8-2604.12"
  14927. }
  14928. }
  14929. }
  14930. },
  14931. "SB_WARMBOOT": {
  14932. "attributes": {
  14933. "keep": "00000000000000000000000000000001",
  14934. "blackbox": "00000000000000000000000000000001",
  14935. "cells_not_processed": "00000000000000000000000000000001",
  14936. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2593.1-2598.10"
  14937. },
  14938. "ports": {
  14939. "BOOT": {
  14940. "direction": "input",
  14941. "bits": [ 2 ]
  14942. },
  14943. "S1": {
  14944. "direction": "input",
  14945. "bits": [ 3 ]
  14946. },
  14947. "S0": {
  14948. "direction": "input",
  14949. "bits": [ 4 ]
  14950. }
  14951. },
  14952. "cells": {
  14953. },
  14954. "netnames": {
  14955. "BOOT": {
  14956. "hide_name": 0,
  14957. "bits": [ 2 ],
  14958. "attributes": {
  14959. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2594.8-2594.12"
  14960. }
  14961. },
  14962. "S0": {
  14963. "hide_name": 0,
  14964. "bits": [ 4 ],
  14965. "attributes": {
  14966. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2596.8-2596.10"
  14967. }
  14968. },
  14969. "S1": {
  14970. "hide_name": 0,
  14971. "bits": [ 3 ],
  14972. "attributes": {
  14973. "src": "/usr/bin/../share/yosys/ice40/cells_sim.v:2595.8-2595.10"
  14974. }
  14975. }
  14976. }
  14977. },
  14978. "delay_toggle": {
  14979. "attributes": {
  14980. "blackbox": "00000000000000000000000000000001",
  14981. "cells_not_processed": "00000000000000000000000000000001",
  14982. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:76.1-86.10"
  14983. },
  14984. "parameter_default_values": {
  14985. "DELAY": "00000000000000000000000000000001"
  14986. },
  14987. "ports": {
  14988. "d": {
  14989. "direction": "input",
  14990. "bits": [ 2 ]
  14991. },
  14992. "q": {
  14993. "direction": "output",
  14994. "bits": [ 3 ]
  14995. },
  14996. "clk": {
  14997. "direction": "input",
  14998. "bits": [ 4 ]
  14999. }
  15000. },
  15001. "cells": {
  15002. },
  15003. "netnames": {
  15004. "clk": {
  15005. "hide_name": 0,
  15006. "bits": [ 4 ],
  15007. "attributes": {
  15008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:81.14-81.17"
  15009. }
  15010. },
  15011. "d": {
  15012. "hide_name": 0,
  15013. "bits": [ 2 ],
  15014. "attributes": {
  15015. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:79.14-79.15"
  15016. }
  15017. },
  15018. "q": {
  15019. "hide_name": 0,
  15020. "bits": [ 3 ],
  15021. "attributes": {
  15022. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:80.14-80.15"
  15023. }
  15024. }
  15025. }
  15026. },
  15027. "top": {
  15028. "attributes": {
  15029. "keep": "00000000000000000000000000000001",
  15030. "dynports": "00000000000000000000000000000001",
  15031. "top": "00000000000000000000000000000001",
  15032. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:12.1-469.10"
  15033. },
  15034. "ports": {
  15035. "spi_io": {
  15036. "direction": "inout",
  15037. "bits": [ 2, 3, 4, 5 ]
  15038. },
  15039. "spi_sck": {
  15040. "direction": "inout",
  15041. "bits": [ 6 ]
  15042. },
  15043. "spi_cs_n": {
  15044. "direction": "inout",
  15045. "bits": [ 7, 8 ]
  15046. },
  15047. "hdmi_r": {
  15048. "direction": "output",
  15049. "bits": [ 9, 10, 11, 12 ]
  15050. },
  15051. "hdmi_g": {
  15052. "direction": "output",
  15053. "bits": [ 13, 14, 15, 16 ]
  15054. },
  15055. "hdmi_b": {
  15056. "direction": "output",
  15057. "bits": [ 17, 18, 19, 20 ]
  15058. },
  15059. "hdmi_hsync": {
  15060. "direction": "output",
  15061. "bits": [ 21 ]
  15062. },
  15063. "hdmi_vsync": {
  15064. "direction": "output",
  15065. "bits": [ 22 ]
  15066. },
  15067. "hdmi_de": {
  15068. "direction": "output",
  15069. "bits": [ 23 ]
  15070. },
  15071. "hdmi_clk": {
  15072. "direction": "output",
  15073. "bits": [ 24 ]
  15074. },
  15075. "uart_rx": {
  15076. "direction": "input",
  15077. "bits": [ 25 ]
  15078. },
  15079. "uart_tx": {
  15080. "direction": "output",
  15081. "bits": [ 26 ]
  15082. },
  15083. "btn": {
  15084. "direction": "input",
  15085. "bits": [ 27 ]
  15086. },
  15087. "rgb": {
  15088. "direction": "output",
  15089. "bits": [ 28, 29, 30 ]
  15090. },
  15091. "clk_in": {
  15092. "direction": "input",
  15093. "bits": [ 31 ]
  15094. }
  15095. },
  15096. "cells": {
  15097. "$flatten\\cache_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:76$4640": {
  15098. "hide_name": 1,
  15099. "type": "$print",
  15100. "parameters": {
  15101. "ARGS_WIDTH": "00000000000000000000000000000000",
  15102. "FORMAT": "Memory cache config :\n",
  15103. "PRIORITY": "11111111111111111111111111111111",
  15104. "TRG_ENABLE": "00000000000000000000000000000001",
  15105. "TRG_POLARITY": "",
  15106. "TRG_WIDTH": "00000000000000000000000000000000"
  15107. },
  15108. "attributes": {
  15109. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:76.3-76.37"
  15110. },
  15111. "port_directions": {
  15112. "ARGS": "input",
  15113. "EN": "input",
  15114. "TRG": "input"
  15115. },
  15116. "connections": {
  15117. "ARGS": [ ],
  15118. "EN": [ "1" ],
  15119. "TRG": [ ]
  15120. }
  15121. },
  15122. "$flatten\\cache_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:77$4641": {
  15123. "hide_name": 1,
  15124. "type": "$print",
  15125. "parameters": {
  15126. "ARGS_WIDTH": "00000000000000000000000000100000",
  15127. "FORMAT": " - {32:> 11d-s} ways\n",
  15128. "PRIORITY": "11111111111111111111111111111110",
  15129. "TRG_ENABLE": "00000000000000000000000000000001",
  15130. "TRG_POLARITY": "",
  15131. "TRG_WIDTH": "00000000000000000000000000000000"
  15132. },
  15133. "attributes": {
  15134. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:77.3-77.34"
  15135. },
  15136. "port_directions": {
  15137. "ARGS": "input",
  15138. "EN": "input",
  15139. "TRG": "input"
  15140. },
  15141. "connections": {
  15142. "ARGS": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15143. "EN": [ "1" ],
  15144. "TRG": [ ]
  15145. }
  15146. },
  15147. "$flatten\\cache_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:78$4642": {
  15148. "hide_name": 1,
  15149. "type": "$print",
  15150. "parameters": {
  15151. "ARGS_WIDTH": "00000000000000000000000000100000",
  15152. "FORMAT": " - {32:> 11d-s} kbytes cache\n",
  15153. "PRIORITY": "11111111111111111111111111111101",
  15154. "TRG_ENABLE": "00000000000000000000000000000001",
  15155. "TRG_POLARITY": "",
  15156. "TRG_WIDTH": "00000000000000000000000000000000"
  15157. },
  15158. "attributes": {
  15159. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:78.3-78.46"
  15160. },
  15161. "port_directions": {
  15162. "ARGS": "input",
  15163. "EN": "input",
  15164. "TRG": "input"
  15165. },
  15166. "connections": {
  15167. "ARGS": [ "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15168. "EN": [ "1" ],
  15169. "TRG": [ ]
  15170. }
  15171. },
  15172. "$flatten\\cache_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:79$4643": {
  15173. "hide_name": 1,
  15174. "type": "$print",
  15175. "parameters": {
  15176. "ARGS_WIDTH": "00000000000000000000000000100000",
  15177. "FORMAT": " - {32:> 11d-s} bytes cache lines\n",
  15178. "PRIORITY": "11111111111111111111111111111100",
  15179. "TRG_ENABLE": "00000000000000000000000000000001",
  15180. "TRG_POLARITY": "",
  15181. "TRG_WIDTH": "00000000000000000000000000000000"
  15182. },
  15183. "attributes": {
  15184. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:79.3-79.51"
  15185. },
  15186. "port_directions": {
  15187. "ARGS": "input",
  15188. "EN": "input",
  15189. "TRG": "input"
  15190. },
  15191. "connections": {
  15192. "ARGS": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15193. "EN": [ "1" ],
  15194. "TRG": [ ]
  15195. }
  15196. },
  15197. "$flatten\\cache_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:80$4644": {
  15198. "hide_name": 1,
  15199. "type": "$print",
  15200. "parameters": {
  15201. "ARGS_WIDTH": "00000000000000000000000000100000",
  15202. "FORMAT": " - {32:> 11d-s} Mbytes address space\n",
  15203. "PRIORITY": "11111111111111111111111111111011",
  15204. "TRG_ENABLE": "00000000000000000000000000000001",
  15205. "TRG_POLARITY": "",
  15206. "TRG_WIDTH": "00000000000000000000000000000000"
  15207. },
  15208. "attributes": {
  15209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:80.3-80.66"
  15210. },
  15211. "port_directions": {
  15212. "ARGS": "input",
  15213. "EN": "input",
  15214. "TRG": "input"
  15215. },
  15216. "connections": {
  15217. "ARGS": [ "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15218. "EN": [ "1" ],
  15219. "TRG": [ ]
  15220. }
  15221. },
  15222. "$flatten\\cache_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:81$4645": {
  15223. "hide_name": 1,
  15224. "type": "$print",
  15225. "parameters": {
  15226. "ARGS_WIDTH": "00000000000000000000000001100000",
  15227. "FORMAT": " - {32:> 11d-s}/{32:> 11d-s}/{32:> 11d-s} address split\n",
  15228. "PRIORITY": "11111111111111111111111111111010",
  15229. "TRG_ENABLE": "00000000000000000000000000000001",
  15230. "TRG_POLARITY": "",
  15231. "TRG_WIDTH": "00000000000000000000000000000000"
  15232. },
  15233. "attributes": {
  15234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:81.3-81.74"
  15235. },
  15236. "port_directions": {
  15237. "ARGS": "input",
  15238. "EN": "input",
  15239. "TRG": "input"
  15240. },
  15241. "connections": {
  15242. "ARGS": [ "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15243. "EN": [ "1" ],
  15244. "TRG": [ ]
  15245. }
  15246. },
  15247. "$flatten\\cache_I.\\data_ram_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:45$3675": {
  15248. "hide_name": 1,
  15249. "type": "$print",
  15250. "parameters": {
  15251. "ARGS_WIDTH": "00000000000000000000000010000000",
  15252. "FORMAT": "ice40_spram_gen: ({32:> 11d-s}x{32:> 11d-s}) -> {32:> 11d-s}x{32:> 11d-s} array of SPRAM\n\n",
  15253. "PRIORITY": "11111111111111111111111111111111",
  15254. "TRG_ENABLE": "00000000000000000000000000000001",
  15255. "TRG_POLARITY": "",
  15256. "TRG_WIDTH": "00000000000000000000000000000000"
  15257. },
  15258. "attributes": {
  15259. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:45.3-45.103"
  15260. },
  15261. "port_directions": {
  15262. "ARGS": "input",
  15263. "EN": "input",
  15264. "TRG": "input"
  15265. },
  15266. "connections": {
  15267. "ARGS": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15268. "EN": [ "1" ],
  15269. "TRG": [ ]
  15270. }
  15271. },
  15272. "$flatten\\cache_I.\\genblk1[0].tag_ram_I.$display$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:72$4453": {
  15273. "hide_name": 1,
  15274. "type": "$print",
  15275. "parameters": {
  15276. "ARGS_WIDTH": "00000000000000000000000001100000",
  15277. "FORMAT": "Cache tag memory config, {32:> 11d-s} x {32:> 11d-s} x {32:> 11d-s}\n",
  15278. "PRIORITY": "11111111111111111111111111111111",
  15279. "TRG_ENABLE": "00000000000000000000000000000001",
  15280. "TRG_POLARITY": "",
  15281. "TRG_WIDTH": "00000000000000000000000000000000"
  15282. },
  15283. "attributes": {
  15284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:72.3-72.93"
  15285. },
  15286. "port_directions": {
  15287. "ARGS": "input",
  15288. "EN": "input",
  15289. "TRG": "input"
  15290. },
  15291. "connections": {
  15292. "ARGS": [ "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  15293. "EN": [ "1" ],
  15294. "TRG": [ ]
  15295. }
  15296. },
  15297. "bram_I.mem.0.0": {
  15298. "hide_name": 0,
  15299. "type": "SB_RAM40_4K",
  15300. "parameters": {
  15301. "INIT_0": "0100010100010101000011010000000111000011000001010100011100010101010101010101000111100111011010011100001100000101010001110001010110001101000000010000000100100111111001010110000111101011101011011110101100100001000011110000000101000001001001110000010100110111",
  15302. "INIT_1": "0000110100000001010000110000010100001101000000010100001100000101000011010000000101000011000001010100101100000001000011010000000101000111000101010000110100000001010000110000010100001101000000010100001100000101001001110011011111100011001001111000010101010001",
  15303. "INIT_2": "0100011100010101100001010101000111000001000001010000110100000001010000110000010101001011000000010000110100000001010001110001010100001101000000010100001100000101000011010000000101000011000001010000110100000001010000110000010100101111000000010100011100010101",
  15304. "INIT_3": "1000010101010001100011010000000100000001001001111000110100000001000000010010011101000111000101010100010101101001000000110000011100000001001011111000110100000001001000110010000100100111001001010010001110101101110000110000011101000011000101110000001100000111",
  15305. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx0000110111100001001111000000111000001100001111100000110000001110",
  15306. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15307. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15308. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15309. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15310. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15311. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15312. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15313. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15314. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15315. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15316. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15317. "READ_MODE": "00",
  15318. "WRITE_MODE": "00"
  15319. },
  15320. "attributes": {
  15321. "module_not_derived": "00000000000000000000000000000001",
  15322. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  15323. },
  15324. "port_directions": {
  15325. "MASK": "input",
  15326. "RADDR": "input",
  15327. "RCLK": "input",
  15328. "RCLKE": "input",
  15329. "RDATA": "output",
  15330. "RE": "input",
  15331. "WADDR": "input",
  15332. "WCLK": "input",
  15333. "WCLKE": "input",
  15334. "WDATA": "input",
  15335. "WE": "input"
  15336. },
  15337. "connections": {
  15338. "MASK": [ 32, 33, 32, 33, 32, 33, 32, 33, 32, 33, 32, 33, 32, 33, 32, 33 ],
  15339. "RADDR": [ 34, 35, 36, 37, 38, 39, 40, 41, "0", "0", "0" ],
  15340. "RCLK": [ 42 ],
  15341. "RCLKE": [ "1" ],
  15342. "RDATA": [ 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58 ],
  15343. "RE": [ "1" ],
  15344. "WADDR": [ 34, 35, 36, 37, 38, 39, 40, 41, "0", "0", "0" ],
  15345. "WCLK": [ 42 ],
  15346. "WCLKE": [ 59 ],
  15347. "WDATA": [ 60, 61, 62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75 ],
  15348. "WE": [ "1" ]
  15349. }
  15350. },
  15351. "bram_I.mem.0.0_WCLKE_SB_LUT4_O": {
  15352. "hide_name": 0,
  15353. "type": "SB_LUT4",
  15354. "parameters": {
  15355. "LUT_INIT": "0000111111111111"
  15356. },
  15357. "attributes": {
  15358. "module_not_derived": "00000000000000000000000000000001",
  15359. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15360. },
  15361. "port_directions": {
  15362. "I0": "input",
  15363. "I1": "input",
  15364. "I2": "input",
  15365. "I3": "input",
  15366. "O": "output"
  15367. },
  15368. "connections": {
  15369. "I0": [ "0" ],
  15370. "I1": [ "0" ],
  15371. "I2": [ 32 ],
  15372. "I3": [ 33 ],
  15373. "O": [ 59 ]
  15374. }
  15375. },
  15376. "bram_I.mem.0.1": {
  15377. "hide_name": 0,
  15378. "type": "SB_RAM40_4K",
  15379. "parameters": {
  15380. "INIT_0": "0000000010000100000000000100010001000111011001000000000100000000010000000000001010101011101010001110111111101110000000000000001001000101000000000000000000100100101110111011100000010001000101000100000100000000010001000001010100000100010001101000001000000000",
  15381. "INIT_1": "0001000101010101000001000000000000010001010101010000000001000000000100010101010100000000010000000101000101010001000100010111010100101000000010000001000101010101000001000000000000010001010101010000000001000000100000000000000000000000000000000000000000000000",
  15382. "INIT_2": "1000001000000000000000000000000000010001000100010001000101010101000000000100000001010001010100010001000101110101000010000010101000010001010101010000010000000010000100010101010100000000010000000001000101010101000000000100000000010011011101011000010110000001",
  15383. "INIT_3": "0000000000000000010001010000000001000100000000000100010100000000010000000100010010000010000000001010111011101000111011111110111100000000010100010100000101000010000100010001000000010101010101000100000001010011010000110100001100000000000000000100000000000000",
  15384. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx0000111011110001000011101100000100001111001111100000111100001110",
  15385. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15386. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15387. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15388. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15389. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15390. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15391. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15392. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15393. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15394. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15395. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  15396. "READ_MODE": "00",
  15397. "WRITE_MODE": "00"
  15398. },
  15399. "attributes": {
  15400. "module_not_derived": "00000000000000000000000000000001",
  15401. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  15402. },
  15403. "port_directions": {
  15404. "MASK": "input",
  15405. "RADDR": "input",
  15406. "RCLK": "input",
  15407. "RCLKE": "input",
  15408. "RDATA": "output",
  15409. "RE": "input",
  15410. "WADDR": "input",
  15411. "WCLK": "input",
  15412. "WCLKE": "input",
  15413. "WDATA": "input",
  15414. "WE": "input"
  15415. },
  15416. "connections": {
  15417. "MASK": [ 76, 77, 76, 77, 76, 77, 76, 77, 76, 77, 76, 77, 76, 77, 76, 77 ],
  15418. "RADDR": [ 34, 35, 36, 37, 38, 39, 40, 41, "0", "0", "0" ],
  15419. "RCLK": [ 42 ],
  15420. "RCLKE": [ "1" ],
  15421. "RDATA": [ 78, 79, 80, 81, 82, 83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93 ],
  15422. "RE": [ "1" ],
  15423. "WADDR": [ 34, 35, 36, 37, 38, 39, 40, 41, "0", "0", "0" ],
  15424. "WCLK": [ 42 ],
  15425. "WCLKE": [ 94 ],
  15426. "WDATA": [ 95, 96, 97, 98, 99, 100, 101, 102, 103, 104, 105, 106, 107, 108, 109, 110 ],
  15427. "WE": [ "1" ]
  15428. }
  15429. },
  15430. "bram_I.mem.0.1_WCLKE_SB_LUT4_O": {
  15431. "hide_name": 0,
  15432. "type": "SB_LUT4",
  15433. "parameters": {
  15434. "LUT_INIT": "0000111111111111"
  15435. },
  15436. "attributes": {
  15437. "module_not_derived": "00000000000000000000000000000001",
  15438. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15439. },
  15440. "port_directions": {
  15441. "I0": "input",
  15442. "I1": "input",
  15443. "I2": "input",
  15444. "I3": "input",
  15445. "O": "output"
  15446. },
  15447. "connections": {
  15448. "I0": [ "0" ],
  15449. "I1": [ "0" ],
  15450. "I2": [ 76 ],
  15451. "I3": [ 77 ],
  15452. "O": [ 94 ]
  15453. }
  15454. },
  15455. "cache_I.cnt_ofs_SB_DFFSR_Q": {
  15456. "hide_name": 0,
  15457. "type": "SB_DFFSR",
  15458. "parameters": {
  15459. },
  15460. "attributes": {
  15461. "module_not_derived": "00000000000000000000000000000001",
  15462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:220.2-224.27|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  15463. },
  15464. "port_directions": {
  15465. "C": "input",
  15466. "D": "input",
  15467. "Q": "output",
  15468. "R": "input"
  15469. },
  15470. "connections": {
  15471. "C": [ 42 ],
  15472. "D": [ 111 ],
  15473. "Q": [ 112 ],
  15474. "R": [ 113 ]
  15475. }
  15476. },
  15477. "cache_I.cnt_ofs_SB_DFFSR_Q_1": {
  15478. "hide_name": 0,
  15479. "type": "SB_DFFSR",
  15480. "parameters": {
  15481. },
  15482. "attributes": {
  15483. "module_not_derived": "00000000000000000000000000000001",
  15484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:220.2-224.27|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  15485. },
  15486. "port_directions": {
  15487. "C": "input",
  15488. "D": "input",
  15489. "Q": "output",
  15490. "R": "input"
  15491. },
  15492. "connections": {
  15493. "C": [ 42 ],
  15494. "D": [ 114 ],
  15495. "Q": [ 115 ],
  15496. "R": [ 113 ]
  15497. }
  15498. },
  15499. "cache_I.cnt_ofs_SB_DFFSR_Q_1_D_SB_LUT4_O": {
  15500. "hide_name": 0,
  15501. "type": "SB_LUT4",
  15502. "parameters": {
  15503. "LUT_INIT": "1010010111110000"
  15504. },
  15505. "attributes": {
  15506. "module_not_derived": "00000000000000000000000000000001",
  15507. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:224.15-224.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15508. },
  15509. "port_directions": {
  15510. "I0": "input",
  15511. "I1": "input",
  15512. "I2": "input",
  15513. "I3": "input",
  15514. "O": "output"
  15515. },
  15516. "connections": {
  15517. "I0": [ 116 ],
  15518. "I1": [ "0" ],
  15519. "I2": [ 115 ],
  15520. "I3": [ 117 ],
  15521. "O": [ 114 ]
  15522. }
  15523. },
  15524. "cache_I.cnt_ofs_SB_DFFSR_Q_2": {
  15525. "hide_name": 0,
  15526. "type": "SB_DFFSR",
  15527. "parameters": {
  15528. },
  15529. "attributes": {
  15530. "module_not_derived": "00000000000000000000000000000001",
  15531. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:220.2-224.27|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  15532. },
  15533. "port_directions": {
  15534. "C": "input",
  15535. "D": "input",
  15536. "Q": "output",
  15537. "R": "input"
  15538. },
  15539. "connections": {
  15540. "C": [ 42 ],
  15541. "D": [ 118 ],
  15542. "Q": [ 117 ],
  15543. "R": [ 113 ]
  15544. }
  15545. },
  15546. "cache_I.cnt_ofs_SB_DFFSR_Q_2_D_SB_LUT4_O": {
  15547. "hide_name": 0,
  15548. "type": "SB_LUT4",
  15549. "parameters": {
  15550. "LUT_INIT": "1111000000001111"
  15551. },
  15552. "attributes": {
  15553. "module_not_derived": "00000000000000000000000000000001",
  15554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15555. },
  15556. "port_directions": {
  15557. "I0": "input",
  15558. "I1": "input",
  15559. "I2": "input",
  15560. "I3": "input",
  15561. "O": "output"
  15562. },
  15563. "connections": {
  15564. "I0": [ "0" ],
  15565. "I1": [ "0" ],
  15566. "I2": [ 117 ],
  15567. "I3": [ 116 ],
  15568. "O": [ 118 ]
  15569. }
  15570. },
  15571. "cache_I.cnt_ofs_SB_DFFSR_Q_D_SB_LUT4_O": {
  15572. "hide_name": 0,
  15573. "type": "SB_LUT4",
  15574. "parameters": {
  15575. "LUT_INIT": "1010010111110000"
  15576. },
  15577. "attributes": {
  15578. "module_not_derived": "00000000000000000000000000000001",
  15579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:224.15-224.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15580. },
  15581. "port_directions": {
  15582. "I0": "input",
  15583. "I1": "input",
  15584. "I2": "input",
  15585. "I3": "input",
  15586. "O": "output"
  15587. },
  15588. "connections": {
  15589. "I0": [ 116 ],
  15590. "I1": [ "0" ],
  15591. "I2": [ 112 ],
  15592. "I3": [ 119 ],
  15593. "O": [ 111 ]
  15594. }
  15595. },
  15596. "cache_I.cnt_ofs_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO": {
  15597. "hide_name": 0,
  15598. "type": "SB_CARRY",
  15599. "parameters": {
  15600. },
  15601. "attributes": {
  15602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:224.15-224.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  15603. },
  15604. "port_directions": {
  15605. "CI": "input",
  15606. "CO": "output",
  15607. "I0": "input",
  15608. "I1": "input"
  15609. },
  15610. "connections": {
  15611. "CI": [ 117 ],
  15612. "CO": [ 119 ],
  15613. "I0": [ "0" ],
  15614. "I1": [ 115 ]
  15615. }
  15616. },
  15617. "cache_I.cnt_ofs_SB_DFFSR_Q_R_SB_LUT4_O": {
  15618. "hide_name": 0,
  15619. "type": "SB_LUT4",
  15620. "parameters": {
  15621. "LUT_INIT": "1100111100001111"
  15622. },
  15623. "attributes": {
  15624. "module_not_derived": "00000000000000000000000000000001",
  15625. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  15626. },
  15627. "port_directions": {
  15628. "I0": "input",
  15629. "I1": "input",
  15630. "I2": "input",
  15631. "I3": "input",
  15632. "O": "output"
  15633. },
  15634. "connections": {
  15635. "I0": [ "0" ],
  15636. "I1": [ 120 ],
  15637. "I2": [ 121 ],
  15638. "I3": [ 122 ],
  15639. "O": [ 113 ]
  15640. }
  15641. },
  15642. "cache_I.ctrl_bus_mode_SB_LUT4_O": {
  15643. "hide_name": 0,
  15644. "type": "SB_LUT4",
  15645. "parameters": {
  15646. "LUT_INIT": "0000000000001111"
  15647. },
  15648. "attributes": {
  15649. "module_not_derived": "00000000000000000000000000000001",
  15650. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15651. },
  15652. "port_directions": {
  15653. "I0": "input",
  15654. "I1": "input",
  15655. "I2": "input",
  15656. "I3": "input",
  15657. "O": "output"
  15658. },
  15659. "connections": {
  15660. "I0": [ "0" ],
  15661. "I1": [ "0" ],
  15662. "I2": [ 123 ],
  15663. "I3": [ 124 ],
  15664. "O": [ 125 ]
  15665. }
  15666. },
  15667. "cache_I.ctrl_state_nxt_SB_DFFR_D": {
  15668. "hide_name": 0,
  15669. "type": "SB_DFFR",
  15670. "parameters": {
  15671. },
  15672. "attributes": {
  15673. "module_not_derived": "00000000000000000000000000000001",
  15674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:167.2-171.33|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  15675. },
  15676. "port_directions": {
  15677. "C": "input",
  15678. "D": "input",
  15679. "Q": "output",
  15680. "R": "input"
  15681. },
  15682. "connections": {
  15683. "C": [ 42 ],
  15684. "D": [ 126 ],
  15685. "Q": [ 123 ],
  15686. "R": [ 127 ]
  15687. }
  15688. },
  15689. "cache_I.ctrl_state_nxt_SB_DFFR_D_1": {
  15690. "hide_name": 0,
  15691. "type": "SB_DFFR",
  15692. "parameters": {
  15693. },
  15694. "attributes": {
  15695. "module_not_derived": "00000000000000000000000000000001",
  15696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:167.2-171.33|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  15697. },
  15698. "port_directions": {
  15699. "C": "input",
  15700. "D": "input",
  15701. "Q": "output",
  15702. "R": "input"
  15703. },
  15704. "connections": {
  15705. "C": [ 42 ],
  15706. "D": [ 128 ],
  15707. "Q": [ 124 ],
  15708. "R": [ 127 ]
  15709. }
  15710. },
  15711. "cache_I.ctrl_state_nxt_SB_LUT4_O": {
  15712. "hide_name": 0,
  15713. "type": "SB_LUT4",
  15714. "parameters": {
  15715. "LUT_INIT": "1111111100001111"
  15716. },
  15717. "attributes": {
  15718. "module_not_derived": "00000000000000000000000000000001",
  15719. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15720. },
  15721. "port_directions": {
  15722. "I0": "input",
  15723. "I1": "input",
  15724. "I2": "input",
  15725. "I3": "input",
  15726. "O": "output"
  15727. },
  15728. "connections": {
  15729. "I0": [ "0" ],
  15730. "I1": [ "0" ],
  15731. "I2": [ 129 ],
  15732. "I3": [ 130 ],
  15733. "O": [ 126 ]
  15734. }
  15735. },
  15736. "cache_I.ctrl_state_nxt_SB_LUT4_O_1": {
  15737. "hide_name": 0,
  15738. "type": "SB_LUT4",
  15739. "parameters": {
  15740. "LUT_INIT": "1111111100001111"
  15741. },
  15742. "attributes": {
  15743. "module_not_derived": "00000000000000000000000000000001",
  15744. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15745. },
  15746. "port_directions": {
  15747. "I0": "input",
  15748. "I1": "input",
  15749. "I2": "input",
  15750. "I3": "input",
  15751. "O": "output"
  15752. },
  15753. "connections": {
  15754. "I0": [ "0" ],
  15755. "I1": [ "0" ],
  15756. "I2": [ 131 ],
  15757. "I3": [ 132 ],
  15758. "O": [ 128 ]
  15759. }
  15760. },
  15761. "cache_I.ctrl_state_nxt_SB_LUT4_O_1_I2_SB_LUT4_O": {
  15762. "hide_name": 0,
  15763. "type": "SB_LUT4",
  15764. "parameters": {
  15765. "LUT_INIT": "0000000011100111"
  15766. },
  15767. "attributes": {
  15768. "module_not_derived": "00000000000000000000000000000001",
  15769. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15770. },
  15771. "port_directions": {
  15772. "I0": "input",
  15773. "I1": "input",
  15774. "I2": "input",
  15775. "I3": "input",
  15776. "O": "output"
  15777. },
  15778. "connections": {
  15779. "I0": [ 133 ],
  15780. "I1": [ 123 ],
  15781. "I2": [ 124 ],
  15782. "I3": [ 134 ],
  15783. "O": [ 131 ]
  15784. }
  15785. },
  15786. "cache_I.ctrl_state_nxt_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  15787. "hide_name": 0,
  15788. "type": "SB_LUT4",
  15789. "parameters": {
  15790. "LUT_INIT": "0000000001000000"
  15791. },
  15792. "attributes": {
  15793. "module_not_derived": "00000000000000000000000000000001",
  15794. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15795. },
  15796. "port_directions": {
  15797. "I0": "input",
  15798. "I1": "input",
  15799. "I2": "input",
  15800. "I3": "input",
  15801. "O": "output"
  15802. },
  15803. "connections": {
  15804. "I0": [ 135 ],
  15805. "I1": [ 136 ],
  15806. "I2": [ 137 ],
  15807. "I3": [ 138 ],
  15808. "O": [ 132 ]
  15809. }
  15810. },
  15811. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O": {
  15812. "hide_name": 0,
  15813. "type": "SB_LUT4",
  15814. "parameters": {
  15815. "LUT_INIT": "0000000011010011"
  15816. },
  15817. "attributes": {
  15818. "module_not_derived": "00000000000000000000000000000001",
  15819. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15820. },
  15821. "port_directions": {
  15822. "I0": "input",
  15823. "I1": "input",
  15824. "I2": "input",
  15825. "I3": "input",
  15826. "O": "output"
  15827. },
  15828. "connections": {
  15829. "I0": [ 133 ],
  15830. "I1": [ 123 ],
  15831. "I2": [ 124 ],
  15832. "I3": [ 134 ],
  15833. "O": [ 129 ]
  15834. }
  15835. },
  15836. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O_1": {
  15837. "hide_name": 0,
  15838. "type": "SB_LUT4",
  15839. "parameters": {
  15840. "LUT_INIT": "0100000000000000"
  15841. },
  15842. "attributes": {
  15843. "module_not_derived": "00000000000000000000000000000001",
  15844. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15845. },
  15846. "port_directions": {
  15847. "I0": "input",
  15848. "I1": "input",
  15849. "I2": "input",
  15850. "I3": "input",
  15851. "O": "output"
  15852. },
  15853. "connections": {
  15854. "I0": [ 135 ],
  15855. "I1": [ 136 ],
  15856. "I2": [ 137 ],
  15857. "I3": [ 138 ],
  15858. "O": [ 130 ]
  15859. }
  15860. },
  15861. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  15862. "hide_name": 0,
  15863. "type": "SB_LUT4",
  15864. "parameters": {
  15865. "LUT_INIT": "0001001100000000"
  15866. },
  15867. "attributes": {
  15868. "module_not_derived": "00000000000000000000000000000001",
  15869. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15870. },
  15871. "port_directions": {
  15872. "I0": "input",
  15873. "I1": "input",
  15874. "I2": "input",
  15875. "I3": "input",
  15876. "O": "output"
  15877. },
  15878. "connections": {
  15879. "I0": [ 139 ],
  15880. "I1": [ 140 ],
  15881. "I2": [ 141 ],
  15882. "I3": [ 142 ],
  15883. "O": [ 138 ]
  15884. }
  15885. },
  15886. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  15887. "hide_name": 0,
  15888. "type": "SB_LUT4",
  15889. "parameters": {
  15890. "LUT_INIT": "0000000011110000"
  15891. },
  15892. "attributes": {
  15893. "module_not_derived": "00000000000000000000000000000001",
  15894. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  15895. },
  15896. "port_directions": {
  15897. "I0": "input",
  15898. "I1": "input",
  15899. "I2": "input",
  15900. "I3": "input",
  15901. "O": "output"
  15902. },
  15903. "connections": {
  15904. "I0": [ "0" ],
  15905. "I1": [ "0" ],
  15906. "I2": [ 143 ],
  15907. "I3": [ 144 ],
  15908. "O": [ 140 ]
  15909. }
  15910. },
  15911. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  15912. "hide_name": 0,
  15913. "type": "SB_LUT4",
  15914. "parameters": {
  15915. "LUT_INIT": "0001010100111111"
  15916. },
  15917. "attributes": {
  15918. "module_not_derived": "00000000000000000000000000000001",
  15919. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15920. },
  15921. "port_directions": {
  15922. "I0": "input",
  15923. "I1": "input",
  15924. "I2": "input",
  15925. "I3": "input",
  15926. "O": "output"
  15927. },
  15928. "connections": {
  15929. "I0": [ 145 ],
  15930. "I1": [ 146 ],
  15931. "I2": [ 147 ],
  15932. "I3": [ 148 ],
  15933. "O": [ 142 ]
  15934. }
  15935. },
  15936. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I": {
  15937. "hide_name": 0,
  15938. "type": "SB_SPRAM256KA",
  15939. "parameters": {
  15940. },
  15941. "attributes": {
  15942. "hdlname": "cache_I data_ram_I genblk1[0].genblk1[0].ram_I",
  15943. "module_not_derived": "00000000000000000000000000000001",
  15944. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:115.19-126.6"
  15945. },
  15946. "port_directions": {
  15947. "ADDRESS": "input",
  15948. "CHIPSELECT": "input",
  15949. "CLOCK": "input",
  15950. "DATAIN": "input",
  15951. "DATAOUT": "output",
  15952. "MASKWREN": "input",
  15953. "POWEROFF": "input",
  15954. "SLEEP": "input",
  15955. "STANDBY": "input",
  15956. "WREN": "input"
  15957. },
  15958. "connections": {
  15959. "ADDRESS": [ 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161, 162 ],
  15960. "CHIPSELECT": [ 163 ],
  15961. "CLOCK": [ 42 ],
  15962. "DATAIN": [ 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176, 177, 178, 179 ],
  15963. "DATAOUT": [ 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191, 192, 193, 194, 195 ],
  15964. "MASKWREN": [ 196, 197, 198, 199 ],
  15965. "POWEROFF": [ "1" ],
  15966. "SLEEP": [ "0" ],
  15967. "STANDBY": [ "0" ],
  15968. "WREN": [ 200 ]
  15969. }
  15970. },
  15971. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_1_SB_LUT4_O": {
  15972. "hide_name": 0,
  15973. "type": "SB_LUT4",
  15974. "parameters": {
  15975. "LUT_INIT": "1111111110101100"
  15976. },
  15977. "attributes": {
  15978. "module_not_derived": "00000000000000000000000000000001",
  15979. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  15980. },
  15981. "port_directions": {
  15982. "I0": "input",
  15983. "I1": "input",
  15984. "I2": "input",
  15985. "I3": "input",
  15986. "O": "output"
  15987. },
  15988. "connections": {
  15989. "I0": [ 201 ],
  15990. "I1": [ 202 ],
  15991. "I2": [ 121 ],
  15992. "I3": [ 203 ],
  15993. "O": [ 161 ]
  15994. }
  15995. },
  15996. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_1_SB_LUT4_O_I3_SB_LUT4_O": {
  15997. "hide_name": 0,
  15998. "type": "SB_LUT4",
  15999. "parameters": {
  16000. "LUT_INIT": "0000000000001100"
  16001. },
  16002. "attributes": {
  16003. "module_not_derived": "00000000000000000000000000000001",
  16004. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16005. },
  16006. "port_directions": {
  16007. "I0": "input",
  16008. "I1": "input",
  16009. "I2": "input",
  16010. "I3": "input",
  16011. "O": "output"
  16012. },
  16013. "connections": {
  16014. "I0": [ "0" ],
  16015. "I1": [ 204 ],
  16016. "I2": [ 205 ],
  16017. "I3": [ 121 ],
  16018. "O": [ 203 ]
  16019. }
  16020. },
  16021. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_2_SB_LUT4_O": {
  16022. "hide_name": 0,
  16023. "type": "SB_LUT4",
  16024. "parameters": {
  16025. "LUT_INIT": "1111000011001100"
  16026. },
  16027. "attributes": {
  16028. "module_not_derived": "00000000000000000000000000000001",
  16029. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16030. },
  16031. "port_directions": {
  16032. "I0": "input",
  16033. "I1": "input",
  16034. "I2": "input",
  16035. "I3": "input",
  16036. "O": "output"
  16037. },
  16038. "connections": {
  16039. "I0": [ "0" ],
  16040. "I1": [ 206 ],
  16041. "I2": [ 112 ],
  16042. "I3": [ 121 ],
  16043. "O": [ 151 ]
  16044. }
  16045. },
  16046. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_3_SB_LUT4_O": {
  16047. "hide_name": 0,
  16048. "type": "SB_LUT4",
  16049. "parameters": {
  16050. "LUT_INIT": "1111000011001100"
  16051. },
  16052. "attributes": {
  16053. "module_not_derived": "00000000000000000000000000000001",
  16054. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16055. },
  16056. "port_directions": {
  16057. "I0": "input",
  16058. "I1": "input",
  16059. "I2": "input",
  16060. "I3": "input",
  16061. "O": "output"
  16062. },
  16063. "connections": {
  16064. "I0": [ "0" ],
  16065. "I1": [ 207 ],
  16066. "I2": [ 115 ],
  16067. "I3": [ 121 ],
  16068. "O": [ 150 ]
  16069. }
  16070. },
  16071. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_4_SB_LUT4_O": {
  16072. "hide_name": 0,
  16073. "type": "SB_LUT4",
  16074. "parameters": {
  16075. "LUT_INIT": "1111000011001100"
  16076. },
  16077. "attributes": {
  16078. "module_not_derived": "00000000000000000000000000000001",
  16079. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16080. },
  16081. "port_directions": {
  16082. "I0": "input",
  16083. "I1": "input",
  16084. "I2": "input",
  16085. "I3": "input",
  16086. "O": "output"
  16087. },
  16088. "connections": {
  16089. "I0": [ "0" ],
  16090. "I1": [ 208 ],
  16091. "I2": [ 117 ],
  16092. "I3": [ 121 ],
  16093. "O": [ 149 ]
  16094. }
  16095. },
  16096. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_SB_LUT4_O": {
  16097. "hide_name": 0,
  16098. "type": "SB_LUT4",
  16099. "parameters": {
  16100. "LUT_INIT": "1010101011111100"
  16101. },
  16102. "attributes": {
  16103. "module_not_derived": "00000000000000000000000000000001",
  16104. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  16105. },
  16106. "port_directions": {
  16107. "I0": "input",
  16108. "I1": "input",
  16109. "I2": "input",
  16110. "I3": "input",
  16111. "O": "output"
  16112. },
  16113. "connections": {
  16114. "I0": [ 209 ],
  16115. "I1": [ 202 ],
  16116. "I2": [ 205 ],
  16117. "I3": [ 121 ],
  16118. "O": [ 162 ]
  16119. }
  16120. },
  16121. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_CHIPSELECT_SB_LUT4_O": {
  16122. "hide_name": 0,
  16123. "type": "SB_LUT4",
  16124. "parameters": {
  16125. "LUT_INIT": "0000111111111111"
  16126. },
  16127. "attributes": {
  16128. "module_not_derived": "00000000000000000000000000000001",
  16129. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  16130. },
  16131. "port_directions": {
  16132. "I0": "input",
  16133. "I1": "input",
  16134. "I2": "input",
  16135. "I3": "input",
  16136. "O": "output"
  16137. },
  16138. "connections": {
  16139. "I0": [ "0" ],
  16140. "I1": [ "0" ],
  16141. "I2": [ 121 ],
  16142. "I3": [ 116 ],
  16143. "O": [ 163 ]
  16144. }
  16145. },
  16146. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_10_SB_LUT4_O": {
  16147. "hide_name": 0,
  16148. "type": "SB_LUT4",
  16149. "parameters": {
  16150. "LUT_INIT": "1111000011001100"
  16151. },
  16152. "attributes": {
  16153. "module_not_derived": "00000000000000000000000000000001",
  16154. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16155. },
  16156. "port_directions": {
  16157. "I0": "input",
  16158. "I1": "input",
  16159. "I2": "input",
  16160. "I3": "input",
  16161. "O": "output"
  16162. },
  16163. "connections": {
  16164. "I0": [ "0" ],
  16165. "I1": [ 69 ],
  16166. "I2": [ 210 ],
  16167. "I3": [ 121 ],
  16168. "O": [ 169 ]
  16169. }
  16170. },
  16171. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_11_SB_LUT4_O": {
  16172. "hide_name": 0,
  16173. "type": "SB_LUT4",
  16174. "parameters": {
  16175. "LUT_INIT": "1100110011110000"
  16176. },
  16177. "attributes": {
  16178. "module_not_derived": "00000000000000000000000000000001",
  16179. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16180. },
  16181. "port_directions": {
  16182. "I0": "input",
  16183. "I1": "input",
  16184. "I2": "input",
  16185. "I3": "input",
  16186. "O": "output"
  16187. },
  16188. "connections": {
  16189. "I0": [ "0" ],
  16190. "I1": [ 211 ],
  16191. "I2": [ 61 ],
  16192. "I3": [ 121 ],
  16193. "O": [ 168 ]
  16194. }
  16195. },
  16196. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_12_SB_LUT4_O": {
  16197. "hide_name": 0,
  16198. "type": "SB_LUT4",
  16199. "parameters": {
  16200. "LUT_INIT": "1111000011001100"
  16201. },
  16202. "attributes": {
  16203. "module_not_derived": "00000000000000000000000000000001",
  16204. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16205. },
  16206. "port_directions": {
  16207. "I0": "input",
  16208. "I1": "input",
  16209. "I2": "input",
  16210. "I3": "input",
  16211. "O": "output"
  16212. },
  16213. "connections": {
  16214. "I0": [ "0" ],
  16215. "I1": [ 72 ],
  16216. "I2": [ 212 ],
  16217. "I3": [ 121 ],
  16218. "O": [ 167 ]
  16219. }
  16220. },
  16221. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_13_SB_LUT4_O": {
  16222. "hide_name": 0,
  16223. "type": "SB_LUT4",
  16224. "parameters": {
  16225. "LUT_INIT": "1111000011001100"
  16226. },
  16227. "attributes": {
  16228. "module_not_derived": "00000000000000000000000000000001",
  16229. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16230. },
  16231. "port_directions": {
  16232. "I0": "input",
  16233. "I1": "input",
  16234. "I2": "input",
  16235. "I3": "input",
  16236. "O": "output"
  16237. },
  16238. "connections": {
  16239. "I0": [ "0" ],
  16240. "I1": [ 64 ],
  16241. "I2": [ 213 ],
  16242. "I3": [ 121 ],
  16243. "O": [ 166 ]
  16244. }
  16245. },
  16246. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_14_SB_LUT4_O": {
  16247. "hide_name": 0,
  16248. "type": "SB_LUT4",
  16249. "parameters": {
  16250. "LUT_INIT": "1100110011110000"
  16251. },
  16252. "attributes": {
  16253. "module_not_derived": "00000000000000000000000000000001",
  16254. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16255. },
  16256. "port_directions": {
  16257. "I0": "input",
  16258. "I1": "input",
  16259. "I2": "input",
  16260. "I3": "input",
  16261. "O": "output"
  16262. },
  16263. "connections": {
  16264. "I0": [ "0" ],
  16265. "I1": [ 214 ],
  16266. "I2": [ 68 ],
  16267. "I3": [ 121 ],
  16268. "O": [ 165 ]
  16269. }
  16270. },
  16271. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_15_SB_LUT4_O": {
  16272. "hide_name": 0,
  16273. "type": "SB_LUT4",
  16274. "parameters": {
  16275. "LUT_INIT": "1111000011001100"
  16276. },
  16277. "attributes": {
  16278. "module_not_derived": "00000000000000000000000000000001",
  16279. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16280. },
  16281. "port_directions": {
  16282. "I0": "input",
  16283. "I1": "input",
  16284. "I2": "input",
  16285. "I3": "input",
  16286. "O": "output"
  16287. },
  16288. "connections": {
  16289. "I0": [ "0" ],
  16290. "I1": [ 60 ],
  16291. "I2": [ 215 ],
  16292. "I3": [ 121 ],
  16293. "O": [ 164 ]
  16294. }
  16295. },
  16296. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_1_SB_LUT4_O": {
  16297. "hide_name": 0,
  16298. "type": "SB_LUT4",
  16299. "parameters": {
  16300. "LUT_INIT": "1100110011110000"
  16301. },
  16302. "attributes": {
  16303. "module_not_derived": "00000000000000000000000000000001",
  16304. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16305. },
  16306. "port_directions": {
  16307. "I0": "input",
  16308. "I1": "input",
  16309. "I2": "input",
  16310. "I3": "input",
  16311. "O": "output"
  16312. },
  16313. "connections": {
  16314. "I0": [ "0" ],
  16315. "I1": [ 216 ],
  16316. "I2": [ 100 ],
  16317. "I3": [ 121 ],
  16318. "O": [ 178 ]
  16319. }
  16320. },
  16321. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_2_SB_LUT4_O": {
  16322. "hide_name": 0,
  16323. "type": "SB_LUT4",
  16324. "parameters": {
  16325. "LUT_INIT": "1111000011001100"
  16326. },
  16327. "attributes": {
  16328. "module_not_derived": "00000000000000000000000000000001",
  16329. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16330. },
  16331. "port_directions": {
  16332. "I0": "input",
  16333. "I1": "input",
  16334. "I2": "input",
  16335. "I3": "input",
  16336. "O": "output"
  16337. },
  16338. "connections": {
  16339. "I0": [ "0" ],
  16340. "I1": [ 104 ],
  16341. "I2": [ 217 ],
  16342. "I3": [ 121 ],
  16343. "O": [ 177 ]
  16344. }
  16345. },
  16346. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_3_SB_LUT4_O": {
  16347. "hide_name": 0,
  16348. "type": "SB_LUT4",
  16349. "parameters": {
  16350. "LUT_INIT": "1100110011110000"
  16351. },
  16352. "attributes": {
  16353. "module_not_derived": "00000000000000000000000000000001",
  16354. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16355. },
  16356. "port_directions": {
  16357. "I0": "input",
  16358. "I1": "input",
  16359. "I2": "input",
  16360. "I3": "input",
  16361. "O": "output"
  16362. },
  16363. "connections": {
  16364. "I0": [ "0" ],
  16365. "I1": [ 218 ],
  16366. "I2": [ 96 ],
  16367. "I3": [ 121 ],
  16368. "O": [ 176 ]
  16369. }
  16370. },
  16371. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_4_SB_LUT4_O": {
  16372. "hide_name": 0,
  16373. "type": "SB_LUT4",
  16374. "parameters": {
  16375. "LUT_INIT": "1100110011110000"
  16376. },
  16377. "attributes": {
  16378. "module_not_derived": "00000000000000000000000000000001",
  16379. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16380. },
  16381. "port_directions": {
  16382. "I0": "input",
  16383. "I1": "input",
  16384. "I2": "input",
  16385. "I3": "input",
  16386. "O": "output"
  16387. },
  16388. "connections": {
  16389. "I0": [ "0" ],
  16390. "I1": [ 219 ],
  16391. "I2": [ 107 ],
  16392. "I3": [ 121 ],
  16393. "O": [ 175 ]
  16394. }
  16395. },
  16396. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_5_SB_LUT4_O": {
  16397. "hide_name": 0,
  16398. "type": "SB_LUT4",
  16399. "parameters": {
  16400. "LUT_INIT": "1111000011001100"
  16401. },
  16402. "attributes": {
  16403. "module_not_derived": "00000000000000000000000000000001",
  16404. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16405. },
  16406. "port_directions": {
  16407. "I0": "input",
  16408. "I1": "input",
  16409. "I2": "input",
  16410. "I3": "input",
  16411. "O": "output"
  16412. },
  16413. "connections": {
  16414. "I0": [ "0" ],
  16415. "I1": [ 99 ],
  16416. "I2": [ 220 ],
  16417. "I3": [ 121 ],
  16418. "O": [ 174 ]
  16419. }
  16420. },
  16421. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_6_SB_LUT4_O": {
  16422. "hide_name": 0,
  16423. "type": "SB_LUT4",
  16424. "parameters": {
  16425. "LUT_INIT": "1111000011001100"
  16426. },
  16427. "attributes": {
  16428. "module_not_derived": "00000000000000000000000000000001",
  16429. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16430. },
  16431. "port_directions": {
  16432. "I0": "input",
  16433. "I1": "input",
  16434. "I2": "input",
  16435. "I3": "input",
  16436. "O": "output"
  16437. },
  16438. "connections": {
  16439. "I0": [ "0" ],
  16440. "I1": [ 103 ],
  16441. "I2": [ 221 ],
  16442. "I3": [ 121 ],
  16443. "O": [ 173 ]
  16444. }
  16445. },
  16446. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_7_SB_LUT4_O": {
  16447. "hide_name": 0,
  16448. "type": "SB_LUT4",
  16449. "parameters": {
  16450. "LUT_INIT": "1111000011001100"
  16451. },
  16452. "attributes": {
  16453. "module_not_derived": "00000000000000000000000000000001",
  16454. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16455. },
  16456. "port_directions": {
  16457. "I0": "input",
  16458. "I1": "input",
  16459. "I2": "input",
  16460. "I3": "input",
  16461. "O": "output"
  16462. },
  16463. "connections": {
  16464. "I0": [ "0" ],
  16465. "I1": [ 95 ],
  16466. "I2": [ 222 ],
  16467. "I3": [ 121 ],
  16468. "O": [ 172 ]
  16469. }
  16470. },
  16471. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_8_SB_LUT4_O": {
  16472. "hide_name": 0,
  16473. "type": "SB_LUT4",
  16474. "parameters": {
  16475. "LUT_INIT": "1111000011001100"
  16476. },
  16477. "attributes": {
  16478. "module_not_derived": "00000000000000000000000000000001",
  16479. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16480. },
  16481. "port_directions": {
  16482. "I0": "input",
  16483. "I1": "input",
  16484. "I2": "input",
  16485. "I3": "input",
  16486. "O": "output"
  16487. },
  16488. "connections": {
  16489. "I0": [ "0" ],
  16490. "I1": [ 73 ],
  16491. "I2": [ 223 ],
  16492. "I3": [ 121 ],
  16493. "O": [ 171 ]
  16494. }
  16495. },
  16496. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_9_SB_LUT4_O": {
  16497. "hide_name": 0,
  16498. "type": "SB_LUT4",
  16499. "parameters": {
  16500. "LUT_INIT": "1100110011110000"
  16501. },
  16502. "attributes": {
  16503. "module_not_derived": "00000000000000000000000000000001",
  16504. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16505. },
  16506. "port_directions": {
  16507. "I0": "input",
  16508. "I1": "input",
  16509. "I2": "input",
  16510. "I3": "input",
  16511. "O": "output"
  16512. },
  16513. "connections": {
  16514. "I0": [ "0" ],
  16515. "I1": [ 224 ],
  16516. "I2": [ 65 ],
  16517. "I3": [ 121 ],
  16518. "O": [ 170 ]
  16519. }
  16520. },
  16521. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_SB_LUT4_O": {
  16522. "hide_name": 0,
  16523. "type": "SB_LUT4",
  16524. "parameters": {
  16525. "LUT_INIT": "1111000011001100"
  16526. },
  16527. "attributes": {
  16528. "module_not_derived": "00000000000000000000000000000001",
  16529. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16530. },
  16531. "port_directions": {
  16532. "I0": "input",
  16533. "I1": "input",
  16534. "I2": "input",
  16535. "I3": "input",
  16536. "O": "output"
  16537. },
  16538. "connections": {
  16539. "I0": [ "0" ],
  16540. "I1": [ 108 ],
  16541. "I2": [ 225 ],
  16542. "I3": [ 121 ],
  16543. "O": [ 179 ]
  16544. }
  16545. },
  16546. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_1_SB_LUT4_O": {
  16547. "hide_name": 0,
  16548. "type": "SB_LUT4",
  16549. "parameters": {
  16550. "LUT_INIT": "1111111111110000"
  16551. },
  16552. "attributes": {
  16553. "module_not_derived": "00000000000000000000000000000001",
  16554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  16555. },
  16556. "port_directions": {
  16557. "I0": "input",
  16558. "I1": "input",
  16559. "I2": "input",
  16560. "I3": "input",
  16561. "O": "output"
  16562. },
  16563. "connections": {
  16564. "I0": [ "0" ],
  16565. "I1": [ "0" ],
  16566. "I2": [ 121 ],
  16567. "I3": [ 226 ],
  16568. "O": [ 198 ]
  16569. }
  16570. },
  16571. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_2_SB_LUT4_O": {
  16572. "hide_name": 0,
  16573. "type": "SB_LUT4",
  16574. "parameters": {
  16575. "LUT_INIT": "1111111111110000"
  16576. },
  16577. "attributes": {
  16578. "module_not_derived": "00000000000000000000000000000001",
  16579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  16580. },
  16581. "port_directions": {
  16582. "I0": "input",
  16583. "I1": "input",
  16584. "I2": "input",
  16585. "I3": "input",
  16586. "O": "output"
  16587. },
  16588. "connections": {
  16589. "I0": [ "0" ],
  16590. "I1": [ "0" ],
  16591. "I2": [ 121 ],
  16592. "I3": [ 227 ],
  16593. "O": [ 197 ]
  16594. }
  16595. },
  16596. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_3_SB_LUT4_O": {
  16597. "hide_name": 0,
  16598. "type": "SB_LUT4",
  16599. "parameters": {
  16600. "LUT_INIT": "1111111111110000"
  16601. },
  16602. "attributes": {
  16603. "module_not_derived": "00000000000000000000000000000001",
  16604. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  16605. },
  16606. "port_directions": {
  16607. "I0": "input",
  16608. "I1": "input",
  16609. "I2": "input",
  16610. "I3": "input",
  16611. "O": "output"
  16612. },
  16613. "connections": {
  16614. "I0": [ "0" ],
  16615. "I1": [ "0" ],
  16616. "I2": [ 228 ],
  16617. "I3": [ 121 ],
  16618. "O": [ 196 ]
  16619. }
  16620. },
  16621. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_SB_LUT4_O": {
  16622. "hide_name": 0,
  16623. "type": "SB_LUT4",
  16624. "parameters": {
  16625. "LUT_INIT": "1111111111110000"
  16626. },
  16627. "attributes": {
  16628. "module_not_derived": "00000000000000000000000000000001",
  16629. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  16630. },
  16631. "port_directions": {
  16632. "I0": "input",
  16633. "I1": "input",
  16634. "I2": "input",
  16635. "I3": "input",
  16636. "O": "output"
  16637. },
  16638. "connections": {
  16639. "I0": [ "0" ],
  16640. "I1": [ "0" ],
  16641. "I2": [ 121 ],
  16642. "I3": [ 229 ],
  16643. "O": [ 199 ]
  16644. }
  16645. },
  16646. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_WREN_SB_LUT4_O": {
  16647. "hide_name": 0,
  16648. "type": "SB_LUT4",
  16649. "parameters": {
  16650. "LUT_INIT": "1000100011111000"
  16651. },
  16652. "attributes": {
  16653. "module_not_derived": "00000000000000000000000000000001",
  16654. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  16655. },
  16656. "port_directions": {
  16657. "I0": "input",
  16658. "I1": "input",
  16659. "I2": "input",
  16660. "I3": "input",
  16661. "O": "output"
  16662. },
  16663. "connections": {
  16664. "I0": [ 230 ],
  16665. "I1": [ 121 ],
  16666. "I2": [ 231 ],
  16667. "I3": [ 232 ],
  16668. "O": [ 200 ]
  16669. }
  16670. },
  16671. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I": {
  16672. "hide_name": 0,
  16673. "type": "SB_SPRAM256KA",
  16674. "parameters": {
  16675. },
  16676. "attributes": {
  16677. "hdlname": "cache_I data_ram_I genblk1[0].genblk1[1].ram_I",
  16678. "module_not_derived": "00000000000000000000000000000001",
  16679. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:115.19-126.6"
  16680. },
  16681. "port_directions": {
  16682. "ADDRESS": "input",
  16683. "CHIPSELECT": "input",
  16684. "CLOCK": "input",
  16685. "DATAIN": "input",
  16686. "DATAOUT": "output",
  16687. "MASKWREN": "input",
  16688. "POWEROFF": "input",
  16689. "SLEEP": "input",
  16690. "STANDBY": "input",
  16691. "WREN": "input"
  16692. },
  16693. "connections": {
  16694. "ADDRESS": [ 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161, 162 ],
  16695. "CHIPSELECT": [ 163 ],
  16696. "CLOCK": [ 42 ],
  16697. "DATAIN": [ 233, 234, 235, 236, 237, 238, 239, 240, 241, 242, 243, 244, 245, 246, 247, 248 ],
  16698. "DATAOUT": [ 249, 250, 251, 252, 253, 254, 255, 256, 257, 258, 259, 260, 261, 262, 263, 264 ],
  16699. "MASKWREN": [ 196, 197, 198, 199 ],
  16700. "POWEROFF": [ "1" ],
  16701. "SLEEP": [ "0" ],
  16702. "STANDBY": [ "0" ],
  16703. "WREN": [ 200 ]
  16704. }
  16705. },
  16706. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_10_SB_LUT4_O": {
  16707. "hide_name": 0,
  16708. "type": "SB_LUT4",
  16709. "parameters": {
  16710. "LUT_INIT": "1111000011001100"
  16711. },
  16712. "attributes": {
  16713. "module_not_derived": "00000000000000000000000000000001",
  16714. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16715. },
  16716. "port_directions": {
  16717. "I0": "input",
  16718. "I1": "input",
  16719. "I2": "input",
  16720. "I3": "input",
  16721. "O": "output"
  16722. },
  16723. "connections": {
  16724. "I0": [ "0" ],
  16725. "I1": [ 71 ],
  16726. "I2": [ 265 ],
  16727. "I3": [ 121 ],
  16728. "O": [ 238 ]
  16729. }
  16730. },
  16731. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_11_SB_LUT4_O": {
  16732. "hide_name": 0,
  16733. "type": "SB_LUT4",
  16734. "parameters": {
  16735. "LUT_INIT": "1111000011001100"
  16736. },
  16737. "attributes": {
  16738. "module_not_derived": "00000000000000000000000000000001",
  16739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16740. },
  16741. "port_directions": {
  16742. "I0": "input",
  16743. "I1": "input",
  16744. "I2": "input",
  16745. "I3": "input",
  16746. "O": "output"
  16747. },
  16748. "connections": {
  16749. "I0": [ "0" ],
  16750. "I1": [ 63 ],
  16751. "I2": [ 266 ],
  16752. "I3": [ 121 ],
  16753. "O": [ 237 ]
  16754. }
  16755. },
  16756. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_12_SB_LUT4_O": {
  16757. "hide_name": 0,
  16758. "type": "SB_LUT4",
  16759. "parameters": {
  16760. "LUT_INIT": "1100110011110000"
  16761. },
  16762. "attributes": {
  16763. "module_not_derived": "00000000000000000000000000000001",
  16764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16765. },
  16766. "port_directions": {
  16767. "I0": "input",
  16768. "I1": "input",
  16769. "I2": "input",
  16770. "I3": "input",
  16771. "O": "output"
  16772. },
  16773. "connections": {
  16774. "I0": [ "0" ],
  16775. "I1": [ 267 ],
  16776. "I2": [ 74 ],
  16777. "I3": [ 121 ],
  16778. "O": [ 236 ]
  16779. }
  16780. },
  16781. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_13_SB_LUT4_O": {
  16782. "hide_name": 0,
  16783. "type": "SB_LUT4",
  16784. "parameters": {
  16785. "LUT_INIT": "1111000011001100"
  16786. },
  16787. "attributes": {
  16788. "module_not_derived": "00000000000000000000000000000001",
  16789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16790. },
  16791. "port_directions": {
  16792. "I0": "input",
  16793. "I1": "input",
  16794. "I2": "input",
  16795. "I3": "input",
  16796. "O": "output"
  16797. },
  16798. "connections": {
  16799. "I0": [ "0" ],
  16800. "I1": [ 66 ],
  16801. "I2": [ 268 ],
  16802. "I3": [ 121 ],
  16803. "O": [ 235 ]
  16804. }
  16805. },
  16806. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_14_SB_LUT4_O": {
  16807. "hide_name": 0,
  16808. "type": "SB_LUT4",
  16809. "parameters": {
  16810. "LUT_INIT": "1111000011001100"
  16811. },
  16812. "attributes": {
  16813. "module_not_derived": "00000000000000000000000000000001",
  16814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16815. },
  16816. "port_directions": {
  16817. "I0": "input",
  16818. "I1": "input",
  16819. "I2": "input",
  16820. "I3": "input",
  16821. "O": "output"
  16822. },
  16823. "connections": {
  16824. "I0": [ "0" ],
  16825. "I1": [ 70 ],
  16826. "I2": [ 269 ],
  16827. "I3": [ 121 ],
  16828. "O": [ 234 ]
  16829. }
  16830. },
  16831. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_15_SB_LUT4_O": {
  16832. "hide_name": 0,
  16833. "type": "SB_LUT4",
  16834. "parameters": {
  16835. "LUT_INIT": "1100110011110000"
  16836. },
  16837. "attributes": {
  16838. "module_not_derived": "00000000000000000000000000000001",
  16839. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16840. },
  16841. "port_directions": {
  16842. "I0": "input",
  16843. "I1": "input",
  16844. "I2": "input",
  16845. "I3": "input",
  16846. "O": "output"
  16847. },
  16848. "connections": {
  16849. "I0": [ "0" ],
  16850. "I1": [ 270 ],
  16851. "I2": [ 62 ],
  16852. "I3": [ 121 ],
  16853. "O": [ 233 ]
  16854. }
  16855. },
  16856. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_1_SB_LUT4_O": {
  16857. "hide_name": 0,
  16858. "type": "SB_LUT4",
  16859. "parameters": {
  16860. "LUT_INIT": "1111000011001100"
  16861. },
  16862. "attributes": {
  16863. "module_not_derived": "00000000000000000000000000000001",
  16864. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16865. },
  16866. "port_directions": {
  16867. "I0": "input",
  16868. "I1": "input",
  16869. "I2": "input",
  16870. "I3": "input",
  16871. "O": "output"
  16872. },
  16873. "connections": {
  16874. "I0": [ "0" ],
  16875. "I1": [ 102 ],
  16876. "I2": [ 271 ],
  16877. "I3": [ 121 ],
  16878. "O": [ 247 ]
  16879. }
  16880. },
  16881. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_2_SB_LUT4_O": {
  16882. "hide_name": 0,
  16883. "type": "SB_LUT4",
  16884. "parameters": {
  16885. "LUT_INIT": "1100110011110000"
  16886. },
  16887. "attributes": {
  16888. "module_not_derived": "00000000000000000000000000000001",
  16889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16890. },
  16891. "port_directions": {
  16892. "I0": "input",
  16893. "I1": "input",
  16894. "I2": "input",
  16895. "I3": "input",
  16896. "O": "output"
  16897. },
  16898. "connections": {
  16899. "I0": [ "0" ],
  16900. "I1": [ 272 ],
  16901. "I2": [ 106 ],
  16902. "I3": [ 121 ],
  16903. "O": [ 246 ]
  16904. }
  16905. },
  16906. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_3_SB_LUT4_O": {
  16907. "hide_name": 0,
  16908. "type": "SB_LUT4",
  16909. "parameters": {
  16910. "LUT_INIT": "1111000011001100"
  16911. },
  16912. "attributes": {
  16913. "module_not_derived": "00000000000000000000000000000001",
  16914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16915. },
  16916. "port_directions": {
  16917. "I0": "input",
  16918. "I1": "input",
  16919. "I2": "input",
  16920. "I3": "input",
  16921. "O": "output"
  16922. },
  16923. "connections": {
  16924. "I0": [ "0" ],
  16925. "I1": [ 98 ],
  16926. "I2": [ 273 ],
  16927. "I3": [ 121 ],
  16928. "O": [ 245 ]
  16929. }
  16930. },
  16931. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_4_SB_LUT4_O": {
  16932. "hide_name": 0,
  16933. "type": "SB_LUT4",
  16934. "parameters": {
  16935. "LUT_INIT": "1100110011110000"
  16936. },
  16937. "attributes": {
  16938. "module_not_derived": "00000000000000000000000000000001",
  16939. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16940. },
  16941. "port_directions": {
  16942. "I0": "input",
  16943. "I1": "input",
  16944. "I2": "input",
  16945. "I3": "input",
  16946. "O": "output"
  16947. },
  16948. "connections": {
  16949. "I0": [ "0" ],
  16950. "I1": [ 274 ],
  16951. "I2": [ 109 ],
  16952. "I3": [ 121 ],
  16953. "O": [ 244 ]
  16954. }
  16955. },
  16956. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_5_SB_LUT4_O": {
  16957. "hide_name": 0,
  16958. "type": "SB_LUT4",
  16959. "parameters": {
  16960. "LUT_INIT": "1111000011001100"
  16961. },
  16962. "attributes": {
  16963. "module_not_derived": "00000000000000000000000000000001",
  16964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16965. },
  16966. "port_directions": {
  16967. "I0": "input",
  16968. "I1": "input",
  16969. "I2": "input",
  16970. "I3": "input",
  16971. "O": "output"
  16972. },
  16973. "connections": {
  16974. "I0": [ "0" ],
  16975. "I1": [ 101 ],
  16976. "I2": [ 275 ],
  16977. "I3": [ 121 ],
  16978. "O": [ 243 ]
  16979. }
  16980. },
  16981. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_6_SB_LUT4_O": {
  16982. "hide_name": 0,
  16983. "type": "SB_LUT4",
  16984. "parameters": {
  16985. "LUT_INIT": "1100110011110000"
  16986. },
  16987. "attributes": {
  16988. "module_not_derived": "00000000000000000000000000000001",
  16989. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  16990. },
  16991. "port_directions": {
  16992. "I0": "input",
  16993. "I1": "input",
  16994. "I2": "input",
  16995. "I3": "input",
  16996. "O": "output"
  16997. },
  16998. "connections": {
  16999. "I0": [ "0" ],
  17000. "I1": [ 276 ],
  17001. "I2": [ 105 ],
  17002. "I3": [ 121 ],
  17003. "O": [ 242 ]
  17004. }
  17005. },
  17006. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_7_SB_LUT4_O": {
  17007. "hide_name": 0,
  17008. "type": "SB_LUT4",
  17009. "parameters": {
  17010. "LUT_INIT": "1111000011001100"
  17011. },
  17012. "attributes": {
  17013. "module_not_derived": "00000000000000000000000000000001",
  17014. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  17015. },
  17016. "port_directions": {
  17017. "I0": "input",
  17018. "I1": "input",
  17019. "I2": "input",
  17020. "I3": "input",
  17021. "O": "output"
  17022. },
  17023. "connections": {
  17024. "I0": [ "0" ],
  17025. "I1": [ 97 ],
  17026. "I2": [ 277 ],
  17027. "I3": [ 121 ],
  17028. "O": [ 241 ]
  17029. }
  17030. },
  17031. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_8_SB_LUT4_O": {
  17032. "hide_name": 0,
  17033. "type": "SB_LUT4",
  17034. "parameters": {
  17035. "LUT_INIT": "1100110011110000"
  17036. },
  17037. "attributes": {
  17038. "module_not_derived": "00000000000000000000000000000001",
  17039. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  17040. },
  17041. "port_directions": {
  17042. "I0": "input",
  17043. "I1": "input",
  17044. "I2": "input",
  17045. "I3": "input",
  17046. "O": "output"
  17047. },
  17048. "connections": {
  17049. "I0": [ "0" ],
  17050. "I1": [ 278 ],
  17051. "I2": [ 75 ],
  17052. "I3": [ 121 ],
  17053. "O": [ 240 ]
  17054. }
  17055. },
  17056. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_9_SB_LUT4_O": {
  17057. "hide_name": 0,
  17058. "type": "SB_LUT4",
  17059. "parameters": {
  17060. "LUT_INIT": "1111000011001100"
  17061. },
  17062. "attributes": {
  17063. "module_not_derived": "00000000000000000000000000000001",
  17064. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  17065. },
  17066. "port_directions": {
  17067. "I0": "input",
  17068. "I1": "input",
  17069. "I2": "input",
  17070. "I3": "input",
  17071. "O": "output"
  17072. },
  17073. "connections": {
  17074. "I0": [ "0" ],
  17075. "I1": [ 67 ],
  17076. "I2": [ 279 ],
  17077. "I3": [ 121 ],
  17078. "O": [ 239 ]
  17079. }
  17080. },
  17081. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_SB_LUT4_O": {
  17082. "hide_name": 0,
  17083. "type": "SB_LUT4",
  17084. "parameters": {
  17085. "LUT_INIT": "1111000011001100"
  17086. },
  17087. "attributes": {
  17088. "module_not_derived": "00000000000000000000000000000001",
  17089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  17090. },
  17091. "port_directions": {
  17092. "I0": "input",
  17093. "I1": "input",
  17094. "I2": "input",
  17095. "I3": "input",
  17096. "O": "output"
  17097. },
  17098. "connections": {
  17099. "I0": [ "0" ],
  17100. "I1": [ 110 ],
  17101. "I2": [ 280 ],
  17102. "I3": [ 121 ],
  17103. "O": [ 248 ]
  17104. }
  17105. },
  17106. "cache_I.ev_tag_SB_LUT4_O": {
  17107. "hide_name": 0,
  17108. "type": "SB_LUT4",
  17109. "parameters": {
  17110. "LUT_INIT": "1110110011111111"
  17111. },
  17112. "attributes": {
  17113. "module_not_derived": "00000000000000000000000000000001",
  17114. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17115. },
  17116. "port_directions": {
  17117. "I0": "input",
  17118. "I1": "input",
  17119. "I2": "input",
  17120. "I3": "input",
  17121. "O": "output"
  17122. },
  17123. "connections": {
  17124. "I0": [ 281 ],
  17125. "I1": [ 282 ],
  17126. "I2": [ 148 ],
  17127. "I3": [ 283 ],
  17128. "O": [ 284 ]
  17129. }
  17130. },
  17131. "cache_I.ev_tag_SB_LUT4_O_1": {
  17132. "hide_name": 0,
  17133. "type": "SB_LUT4",
  17134. "parameters": {
  17135. "LUT_INIT": "0000111111111111"
  17136. },
  17137. "attributes": {
  17138. "module_not_derived": "00000000000000000000000000000001",
  17139. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17140. },
  17141. "port_directions": {
  17142. "I0": "input",
  17143. "I1": "input",
  17144. "I2": "input",
  17145. "I3": "input",
  17146. "O": "output"
  17147. },
  17148. "connections": {
  17149. "I0": [ "0" ],
  17150. "I1": [ "0" ],
  17151. "I2": [ 285 ],
  17152. "I3": [ 286 ],
  17153. "O": [ 287 ]
  17154. }
  17155. },
  17156. "cache_I.ev_tag_SB_LUT4_O_10": {
  17157. "hide_name": 0,
  17158. "type": "SB_LUT4",
  17159. "parameters": {
  17160. "LUT_INIT": "0000111111111111"
  17161. },
  17162. "attributes": {
  17163. "module_not_derived": "00000000000000000000000000000001",
  17164. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17165. },
  17166. "port_directions": {
  17167. "I0": "input",
  17168. "I1": "input",
  17169. "I2": "input",
  17170. "I3": "input",
  17171. "O": "output"
  17172. },
  17173. "connections": {
  17174. "I0": [ "0" ],
  17175. "I1": [ "0" ],
  17176. "I2": [ 288 ],
  17177. "I3": [ 289 ],
  17178. "O": [ 290 ]
  17179. }
  17180. },
  17181. "cache_I.ev_tag_SB_LUT4_O_10_I2_SB_LUT4_O": {
  17182. "hide_name": 0,
  17183. "type": "SB_LUT4",
  17184. "parameters": {
  17185. "LUT_INIT": "0101000111110011"
  17186. },
  17187. "attributes": {
  17188. "module_not_derived": "00000000000000000000000000000001",
  17189. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17190. },
  17191. "port_directions": {
  17192. "I0": "input",
  17193. "I1": "input",
  17194. "I2": "input",
  17195. "I3": "input",
  17196. "O": "output"
  17197. },
  17198. "connections": {
  17199. "I0": [ 291 ],
  17200. "I1": [ 292 ],
  17201. "I2": [ 144 ],
  17202. "I3": [ 141 ],
  17203. "O": [ 288 ]
  17204. }
  17205. },
  17206. "cache_I.ev_tag_SB_LUT4_O_10_I2_SB_LUT4_O_1": {
  17207. "hide_name": 0,
  17208. "type": "SB_LUT4",
  17209. "parameters": {
  17210. "LUT_INIT": "0001010100111111"
  17211. },
  17212. "attributes": {
  17213. "module_not_derived": "00000000000000000000000000000001",
  17214. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17215. },
  17216. "port_directions": {
  17217. "I0": "input",
  17218. "I1": "input",
  17219. "I2": "input",
  17220. "I3": "input",
  17221. "O": "output"
  17222. },
  17223. "connections": {
  17224. "I0": [ 293 ],
  17225. "I1": [ 294 ],
  17226. "I2": [ 147 ],
  17227. "I3": [ 148 ],
  17228. "O": [ 289 ]
  17229. }
  17230. },
  17231. "cache_I.ev_tag_SB_LUT4_O_11": {
  17232. "hide_name": 0,
  17233. "type": "SB_LUT4",
  17234. "parameters": {
  17235. "LUT_INIT": "0000111111111111"
  17236. },
  17237. "attributes": {
  17238. "module_not_derived": "00000000000000000000000000000001",
  17239. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17240. },
  17241. "port_directions": {
  17242. "I0": "input",
  17243. "I1": "input",
  17244. "I2": "input",
  17245. "I3": "input",
  17246. "O": "output"
  17247. },
  17248. "connections": {
  17249. "I0": [ "0" ],
  17250. "I1": [ "0" ],
  17251. "I2": [ 295 ],
  17252. "I3": [ 296 ],
  17253. "O": [ 297 ]
  17254. }
  17255. },
  17256. "cache_I.ev_tag_SB_LUT4_O_11_I2_SB_LUT4_O": {
  17257. "hide_name": 0,
  17258. "type": "SB_LUT4",
  17259. "parameters": {
  17260. "LUT_INIT": "0001010100111111"
  17261. },
  17262. "attributes": {
  17263. "module_not_derived": "00000000000000000000000000000001",
  17264. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17265. },
  17266. "port_directions": {
  17267. "I0": "input",
  17268. "I1": "input",
  17269. "I2": "input",
  17270. "I3": "input",
  17271. "O": "output"
  17272. },
  17273. "connections": {
  17274. "I0": [ 298 ],
  17275. "I1": [ 299 ],
  17276. "I2": [ 147 ],
  17277. "I3": [ 148 ],
  17278. "O": [ 295 ]
  17279. }
  17280. },
  17281. "cache_I.ev_tag_SB_LUT4_O_11_I2_SB_LUT4_O_1": {
  17282. "hide_name": 0,
  17283. "type": "SB_LUT4",
  17284. "parameters": {
  17285. "LUT_INIT": "0101000111110011"
  17286. },
  17287. "attributes": {
  17288. "module_not_derived": "00000000000000000000000000000001",
  17289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17290. },
  17291. "port_directions": {
  17292. "I0": "input",
  17293. "I1": "input",
  17294. "I2": "input",
  17295. "I3": "input",
  17296. "O": "output"
  17297. },
  17298. "connections": {
  17299. "I0": [ 300 ],
  17300. "I1": [ 301 ],
  17301. "I2": [ 144 ],
  17302. "I3": [ 141 ],
  17303. "O": [ 296 ]
  17304. }
  17305. },
  17306. "cache_I.ev_tag_SB_LUT4_O_1_I2_SB_LUT4_O": {
  17307. "hide_name": 0,
  17308. "type": "SB_LUT4",
  17309. "parameters": {
  17310. "LUT_INIT": "0101000111110011"
  17311. },
  17312. "attributes": {
  17313. "module_not_derived": "00000000000000000000000000000001",
  17314. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17315. },
  17316. "port_directions": {
  17317. "I0": "input",
  17318. "I1": "input",
  17319. "I2": "input",
  17320. "I3": "input",
  17321. "O": "output"
  17322. },
  17323. "connections": {
  17324. "I0": [ 302 ],
  17325. "I1": [ 303 ],
  17326. "I2": [ 144 ],
  17327. "I3": [ 141 ],
  17328. "O": [ 285 ]
  17329. }
  17330. },
  17331. "cache_I.ev_tag_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  17332. "hide_name": 0,
  17333. "type": "SB_LUT4",
  17334. "parameters": {
  17335. "LUT_INIT": "0001010100111111"
  17336. },
  17337. "attributes": {
  17338. "module_not_derived": "00000000000000000000000000000001",
  17339. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17340. },
  17341. "port_directions": {
  17342. "I0": "input",
  17343. "I1": "input",
  17344. "I2": "input",
  17345. "I3": "input",
  17346. "O": "output"
  17347. },
  17348. "connections": {
  17349. "I0": [ 304 ],
  17350. "I1": [ 305 ],
  17351. "I2": [ 147 ],
  17352. "I3": [ 148 ],
  17353. "O": [ 286 ]
  17354. }
  17355. },
  17356. "cache_I.ev_tag_SB_LUT4_O_2": {
  17357. "hide_name": 0,
  17358. "type": "SB_LUT4",
  17359. "parameters": {
  17360. "LUT_INIT": "1110110011111111"
  17361. },
  17362. "attributes": {
  17363. "module_not_derived": "00000000000000000000000000000001",
  17364. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17365. },
  17366. "port_directions": {
  17367. "I0": "input",
  17368. "I1": "input",
  17369. "I2": "input",
  17370. "I3": "input",
  17371. "O": "output"
  17372. },
  17373. "connections": {
  17374. "I0": [ 306 ],
  17375. "I1": [ 307 ],
  17376. "I2": [ 148 ],
  17377. "I3": [ 308 ],
  17378. "O": [ 309 ]
  17379. }
  17380. },
  17381. "cache_I.ev_tag_SB_LUT4_O_2_I1_SB_LUT4_O": {
  17382. "hide_name": 0,
  17383. "type": "SB_LUT4",
  17384. "parameters": {
  17385. "LUT_INIT": "0001010100111111"
  17386. },
  17387. "attributes": {
  17388. "module_not_derived": "00000000000000000000000000000001",
  17389. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17390. },
  17391. "port_directions": {
  17392. "I0": "input",
  17393. "I1": "input",
  17394. "I2": "input",
  17395. "I3": "input",
  17396. "O": "output"
  17397. },
  17398. "connections": {
  17399. "I0": [ 310 ],
  17400. "I1": [ 311 ],
  17401. "I2": [ 147 ],
  17402. "I3": [ 141 ],
  17403. "O": [ 308 ]
  17404. }
  17405. },
  17406. "cache_I.ev_tag_SB_LUT4_O_2_I1_SB_LUT4_O_1": {
  17407. "hide_name": 0,
  17408. "type": "SB_LUT4",
  17409. "parameters": {
  17410. "LUT_INIT": "0000000011110000"
  17411. },
  17412. "attributes": {
  17413. "module_not_derived": "00000000000000000000000000000001",
  17414. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17415. },
  17416. "port_directions": {
  17417. "I0": "input",
  17418. "I1": "input",
  17419. "I2": "input",
  17420. "I3": "input",
  17421. "O": "output"
  17422. },
  17423. "connections": {
  17424. "I0": [ "0" ],
  17425. "I1": [ "0" ],
  17426. "I2": [ 312 ],
  17427. "I3": [ 144 ],
  17428. "O": [ 307 ]
  17429. }
  17430. },
  17431. "cache_I.ev_tag_SB_LUT4_O_3": {
  17432. "hide_name": 0,
  17433. "type": "SB_LUT4",
  17434. "parameters": {
  17435. "LUT_INIT": "0000111111111111"
  17436. },
  17437. "attributes": {
  17438. "module_not_derived": "00000000000000000000000000000001",
  17439. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17440. },
  17441. "port_directions": {
  17442. "I0": "input",
  17443. "I1": "input",
  17444. "I2": "input",
  17445. "I3": "input",
  17446. "O": "output"
  17447. },
  17448. "connections": {
  17449. "I0": [ "0" ],
  17450. "I1": [ "0" ],
  17451. "I2": [ 313 ],
  17452. "I3": [ 314 ],
  17453. "O": [ 315 ]
  17454. }
  17455. },
  17456. "cache_I.ev_tag_SB_LUT4_O_3_I2_SB_LUT4_O": {
  17457. "hide_name": 0,
  17458. "type": "SB_LUT4",
  17459. "parameters": {
  17460. "LUT_INIT": "0001001101011111"
  17461. },
  17462. "attributes": {
  17463. "module_not_derived": "00000000000000000000000000000001",
  17464. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17465. },
  17466. "port_directions": {
  17467. "I0": "input",
  17468. "I1": "input",
  17469. "I2": "input",
  17470. "I3": "input",
  17471. "O": "output"
  17472. },
  17473. "connections": {
  17474. "I0": [ 316 ],
  17475. "I1": [ 317 ],
  17476. "I2": [ 147 ],
  17477. "I3": [ 148 ],
  17478. "O": [ 313 ]
  17479. }
  17480. },
  17481. "cache_I.ev_tag_SB_LUT4_O_3_I2_SB_LUT4_O_1": {
  17482. "hide_name": 0,
  17483. "type": "SB_LUT4",
  17484. "parameters": {
  17485. "LUT_INIT": "0011000111110101"
  17486. },
  17487. "attributes": {
  17488. "module_not_derived": "00000000000000000000000000000001",
  17489. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17490. },
  17491. "port_directions": {
  17492. "I0": "input",
  17493. "I1": "input",
  17494. "I2": "input",
  17495. "I3": "input",
  17496. "O": "output"
  17497. },
  17498. "connections": {
  17499. "I0": [ 318 ],
  17500. "I1": [ 319 ],
  17501. "I2": [ 144 ],
  17502. "I3": [ 141 ],
  17503. "O": [ 314 ]
  17504. }
  17505. },
  17506. "cache_I.ev_tag_SB_LUT4_O_4": {
  17507. "hide_name": 0,
  17508. "type": "SB_LUT4",
  17509. "parameters": {
  17510. "LUT_INIT": "0000111111111111"
  17511. },
  17512. "attributes": {
  17513. "module_not_derived": "00000000000000000000000000000001",
  17514. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17515. },
  17516. "port_directions": {
  17517. "I0": "input",
  17518. "I1": "input",
  17519. "I2": "input",
  17520. "I3": "input",
  17521. "O": "output"
  17522. },
  17523. "connections": {
  17524. "I0": [ "0" ],
  17525. "I1": [ "0" ],
  17526. "I2": [ 320 ],
  17527. "I3": [ 321 ],
  17528. "O": [ 322 ]
  17529. }
  17530. },
  17531. "cache_I.ev_tag_SB_LUT4_O_4_I2_SB_LUT4_O": {
  17532. "hide_name": 0,
  17533. "type": "SB_LUT4",
  17534. "parameters": {
  17535. "LUT_INIT": "0011000111110101"
  17536. },
  17537. "attributes": {
  17538. "module_not_derived": "00000000000000000000000000000001",
  17539. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17540. },
  17541. "port_directions": {
  17542. "I0": "input",
  17543. "I1": "input",
  17544. "I2": "input",
  17545. "I3": "input",
  17546. "O": "output"
  17547. },
  17548. "connections": {
  17549. "I0": [ 323 ],
  17550. "I1": [ 324 ],
  17551. "I2": [ 144 ],
  17552. "I3": [ 148 ],
  17553. "O": [ 320 ]
  17554. }
  17555. },
  17556. "cache_I.ev_tag_SB_LUT4_O_4_I2_SB_LUT4_O_1": {
  17557. "hide_name": 0,
  17558. "type": "SB_LUT4",
  17559. "parameters": {
  17560. "LUT_INIT": "0001001101011111"
  17561. },
  17562. "attributes": {
  17563. "module_not_derived": "00000000000000000000000000000001",
  17564. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17565. },
  17566. "port_directions": {
  17567. "I0": "input",
  17568. "I1": "input",
  17569. "I2": "input",
  17570. "I3": "input",
  17571. "O": "output"
  17572. },
  17573. "connections": {
  17574. "I0": [ 325 ],
  17575. "I1": [ 326 ],
  17576. "I2": [ 147 ],
  17577. "I3": [ 141 ],
  17578. "O": [ 321 ]
  17579. }
  17580. },
  17581. "cache_I.ev_tag_SB_LUT4_O_5": {
  17582. "hide_name": 0,
  17583. "type": "SB_LUT4",
  17584. "parameters": {
  17585. "LUT_INIT": "0000111111111111"
  17586. },
  17587. "attributes": {
  17588. "module_not_derived": "00000000000000000000000000000001",
  17589. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17590. },
  17591. "port_directions": {
  17592. "I0": "input",
  17593. "I1": "input",
  17594. "I2": "input",
  17595. "I3": "input",
  17596. "O": "output"
  17597. },
  17598. "connections": {
  17599. "I0": [ "0" ],
  17600. "I1": [ "0" ],
  17601. "I2": [ 327 ],
  17602. "I3": [ 328 ],
  17603. "O": [ 329 ]
  17604. }
  17605. },
  17606. "cache_I.ev_tag_SB_LUT4_O_5_I2_SB_LUT4_O": {
  17607. "hide_name": 0,
  17608. "type": "SB_LUT4",
  17609. "parameters": {
  17610. "LUT_INIT": "0101000111110011"
  17611. },
  17612. "attributes": {
  17613. "module_not_derived": "00000000000000000000000000000001",
  17614. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17615. },
  17616. "port_directions": {
  17617. "I0": "input",
  17618. "I1": "input",
  17619. "I2": "input",
  17620. "I3": "input",
  17621. "O": "output"
  17622. },
  17623. "connections": {
  17624. "I0": [ 330 ],
  17625. "I1": [ 331 ],
  17626. "I2": [ 144 ],
  17627. "I3": [ 141 ],
  17628. "O": [ 327 ]
  17629. }
  17630. },
  17631. "cache_I.ev_tag_SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  17632. "hide_name": 0,
  17633. "type": "SB_LUT4",
  17634. "parameters": {
  17635. "LUT_INIT": "0001001101011111"
  17636. },
  17637. "attributes": {
  17638. "module_not_derived": "00000000000000000000000000000001",
  17639. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17640. },
  17641. "port_directions": {
  17642. "I0": "input",
  17643. "I1": "input",
  17644. "I2": "input",
  17645. "I3": "input",
  17646. "O": "output"
  17647. },
  17648. "connections": {
  17649. "I0": [ 332 ],
  17650. "I1": [ 333 ],
  17651. "I2": [ 147 ],
  17652. "I3": [ 148 ],
  17653. "O": [ 328 ]
  17654. }
  17655. },
  17656. "cache_I.ev_tag_SB_LUT4_O_6": {
  17657. "hide_name": 0,
  17658. "type": "SB_LUT4",
  17659. "parameters": {
  17660. "LUT_INIT": "0000111111111111"
  17661. },
  17662. "attributes": {
  17663. "module_not_derived": "00000000000000000000000000000001",
  17664. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17665. },
  17666. "port_directions": {
  17667. "I0": "input",
  17668. "I1": "input",
  17669. "I2": "input",
  17670. "I3": "input",
  17671. "O": "output"
  17672. },
  17673. "connections": {
  17674. "I0": [ "0" ],
  17675. "I1": [ "0" ],
  17676. "I2": [ 334 ],
  17677. "I3": [ 335 ],
  17678. "O": [ 336 ]
  17679. }
  17680. },
  17681. "cache_I.ev_tag_SB_LUT4_O_6_I2_SB_LUT4_O": {
  17682. "hide_name": 0,
  17683. "type": "SB_LUT4",
  17684. "parameters": {
  17685. "LUT_INIT": "0001001101011111"
  17686. },
  17687. "attributes": {
  17688. "module_not_derived": "00000000000000000000000000000001",
  17689. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17690. },
  17691. "port_directions": {
  17692. "I0": "input",
  17693. "I1": "input",
  17694. "I2": "input",
  17695. "I3": "input",
  17696. "O": "output"
  17697. },
  17698. "connections": {
  17699. "I0": [ 337 ],
  17700. "I1": [ 338 ],
  17701. "I2": [ 147 ],
  17702. "I3": [ 148 ],
  17703. "O": [ 334 ]
  17704. }
  17705. },
  17706. "cache_I.ev_tag_SB_LUT4_O_6_I2_SB_LUT4_O_1": {
  17707. "hide_name": 0,
  17708. "type": "SB_LUT4",
  17709. "parameters": {
  17710. "LUT_INIT": "0101000111110011"
  17711. },
  17712. "attributes": {
  17713. "module_not_derived": "00000000000000000000000000000001",
  17714. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17715. },
  17716. "port_directions": {
  17717. "I0": "input",
  17718. "I1": "input",
  17719. "I2": "input",
  17720. "I3": "input",
  17721. "O": "output"
  17722. },
  17723. "connections": {
  17724. "I0": [ 339 ],
  17725. "I1": [ 340 ],
  17726. "I2": [ 144 ],
  17727. "I3": [ 141 ],
  17728. "O": [ 335 ]
  17729. }
  17730. },
  17731. "cache_I.ev_tag_SB_LUT4_O_7": {
  17732. "hide_name": 0,
  17733. "type": "SB_LUT4",
  17734. "parameters": {
  17735. "LUT_INIT": "0000111111111111"
  17736. },
  17737. "attributes": {
  17738. "module_not_derived": "00000000000000000000000000000001",
  17739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17740. },
  17741. "port_directions": {
  17742. "I0": "input",
  17743. "I1": "input",
  17744. "I2": "input",
  17745. "I3": "input",
  17746. "O": "output"
  17747. },
  17748. "connections": {
  17749. "I0": [ "0" ],
  17750. "I1": [ "0" ],
  17751. "I2": [ 341 ],
  17752. "I3": [ 342 ],
  17753. "O": [ 343 ]
  17754. }
  17755. },
  17756. "cache_I.ev_tag_SB_LUT4_O_7_I2_SB_LUT4_O": {
  17757. "hide_name": 0,
  17758. "type": "SB_LUT4",
  17759. "parameters": {
  17760. "LUT_INIT": "0001001101011111"
  17761. },
  17762. "attributes": {
  17763. "module_not_derived": "00000000000000000000000000000001",
  17764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17765. },
  17766. "port_directions": {
  17767. "I0": "input",
  17768. "I1": "input",
  17769. "I2": "input",
  17770. "I3": "input",
  17771. "O": "output"
  17772. },
  17773. "connections": {
  17774. "I0": [ 344 ],
  17775. "I1": [ 345 ],
  17776. "I2": [ 147 ],
  17777. "I3": [ 148 ],
  17778. "O": [ 341 ]
  17779. }
  17780. },
  17781. "cache_I.ev_tag_SB_LUT4_O_7_I2_SB_LUT4_O_1": {
  17782. "hide_name": 0,
  17783. "type": "SB_LUT4",
  17784. "parameters": {
  17785. "LUT_INIT": "0101000111110011"
  17786. },
  17787. "attributes": {
  17788. "module_not_derived": "00000000000000000000000000000001",
  17789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17790. },
  17791. "port_directions": {
  17792. "I0": "input",
  17793. "I1": "input",
  17794. "I2": "input",
  17795. "I3": "input",
  17796. "O": "output"
  17797. },
  17798. "connections": {
  17799. "I0": [ 346 ],
  17800. "I1": [ 347 ],
  17801. "I2": [ 144 ],
  17802. "I3": [ 141 ],
  17803. "O": [ 342 ]
  17804. }
  17805. },
  17806. "cache_I.ev_tag_SB_LUT4_O_8": {
  17807. "hide_name": 0,
  17808. "type": "SB_LUT4",
  17809. "parameters": {
  17810. "LUT_INIT": "0000111111111111"
  17811. },
  17812. "attributes": {
  17813. "module_not_derived": "00000000000000000000000000000001",
  17814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17815. },
  17816. "port_directions": {
  17817. "I0": "input",
  17818. "I1": "input",
  17819. "I2": "input",
  17820. "I3": "input",
  17821. "O": "output"
  17822. },
  17823. "connections": {
  17824. "I0": [ "0" ],
  17825. "I1": [ "0" ],
  17826. "I2": [ 348 ],
  17827. "I3": [ 349 ],
  17828. "O": [ 350 ]
  17829. }
  17830. },
  17831. "cache_I.ev_tag_SB_LUT4_O_8_I2_SB_LUT4_O": {
  17832. "hide_name": 0,
  17833. "type": "SB_LUT4",
  17834. "parameters": {
  17835. "LUT_INIT": "0011000111110101"
  17836. },
  17837. "attributes": {
  17838. "module_not_derived": "00000000000000000000000000000001",
  17839. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17840. },
  17841. "port_directions": {
  17842. "I0": "input",
  17843. "I1": "input",
  17844. "I2": "input",
  17845. "I3": "input",
  17846. "O": "output"
  17847. },
  17848. "connections": {
  17849. "I0": [ 351 ],
  17850. "I1": [ 352 ],
  17851. "I2": [ 144 ],
  17852. "I3": [ 141 ],
  17853. "O": [ 348 ]
  17854. }
  17855. },
  17856. "cache_I.ev_tag_SB_LUT4_O_8_I2_SB_LUT4_O_1": {
  17857. "hide_name": 0,
  17858. "type": "SB_LUT4",
  17859. "parameters": {
  17860. "LUT_INIT": "0001010100111111"
  17861. },
  17862. "attributes": {
  17863. "module_not_derived": "00000000000000000000000000000001",
  17864. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17865. },
  17866. "port_directions": {
  17867. "I0": "input",
  17868. "I1": "input",
  17869. "I2": "input",
  17870. "I3": "input",
  17871. "O": "output"
  17872. },
  17873. "connections": {
  17874. "I0": [ 353 ],
  17875. "I1": [ 354 ],
  17876. "I2": [ 147 ],
  17877. "I3": [ 148 ],
  17878. "O": [ 349 ]
  17879. }
  17880. },
  17881. "cache_I.ev_tag_SB_LUT4_O_9": {
  17882. "hide_name": 0,
  17883. "type": "SB_LUT4",
  17884. "parameters": {
  17885. "LUT_INIT": "0000111111111111"
  17886. },
  17887. "attributes": {
  17888. "module_not_derived": "00000000000000000000000000000001",
  17889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  17890. },
  17891. "port_directions": {
  17892. "I0": "input",
  17893. "I1": "input",
  17894. "I2": "input",
  17895. "I3": "input",
  17896. "O": "output"
  17897. },
  17898. "connections": {
  17899. "I0": [ "0" ],
  17900. "I1": [ "0" ],
  17901. "I2": [ 355 ],
  17902. "I3": [ 356 ],
  17903. "O": [ 357 ]
  17904. }
  17905. },
  17906. "cache_I.ev_tag_SB_LUT4_O_9_I2_SB_LUT4_O": {
  17907. "hide_name": 0,
  17908. "type": "SB_LUT4",
  17909. "parameters": {
  17910. "LUT_INIT": "0001001101011111"
  17911. },
  17912. "attributes": {
  17913. "module_not_derived": "00000000000000000000000000000001",
  17914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17915. },
  17916. "port_directions": {
  17917. "I0": "input",
  17918. "I1": "input",
  17919. "I2": "input",
  17920. "I3": "input",
  17921. "O": "output"
  17922. },
  17923. "connections": {
  17924. "I0": [ 358 ],
  17925. "I1": [ 359 ],
  17926. "I2": [ 147 ],
  17927. "I3": [ 148 ],
  17928. "O": [ 355 ]
  17929. }
  17930. },
  17931. "cache_I.ev_tag_SB_LUT4_O_9_I2_SB_LUT4_O_1": {
  17932. "hide_name": 0,
  17933. "type": "SB_LUT4",
  17934. "parameters": {
  17935. "LUT_INIT": "0101000111110011"
  17936. },
  17937. "attributes": {
  17938. "module_not_derived": "00000000000000000000000000000001",
  17939. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  17940. },
  17941. "port_directions": {
  17942. "I0": "input",
  17943. "I1": "input",
  17944. "I2": "input",
  17945. "I3": "input",
  17946. "O": "output"
  17947. },
  17948. "connections": {
  17949. "I0": [ 360 ],
  17950. "I1": [ 361 ],
  17951. "I2": [ 144 ],
  17952. "I3": [ 141 ],
  17953. "O": [ 356 ]
  17954. }
  17955. },
  17956. "cache_I.ev_tag_r_SB_DFFE_Q": {
  17957. "hide_name": 0,
  17958. "type": "SB_DFFE",
  17959. "parameters": {
  17960. },
  17961. "attributes": {
  17962. "module_not_derived": "00000000000000000000000000000001",
  17963. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  17964. },
  17965. "port_directions": {
  17966. "C": "input",
  17967. "D": "input",
  17968. "E": "input",
  17969. "Q": "output"
  17970. },
  17971. "connections": {
  17972. "C": [ 42 ],
  17973. "D": [ 290 ],
  17974. "E": [ 125 ],
  17975. "Q": [ 362 ]
  17976. }
  17977. },
  17978. "cache_I.ev_tag_r_SB_DFFE_Q_1": {
  17979. "hide_name": 0,
  17980. "type": "SB_DFFE",
  17981. "parameters": {
  17982. },
  17983. "attributes": {
  17984. "module_not_derived": "00000000000000000000000000000001",
  17985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  17986. },
  17987. "port_directions": {
  17988. "C": "input",
  17989. "D": "input",
  17990. "E": "input",
  17991. "Q": "output"
  17992. },
  17993. "connections": {
  17994. "C": [ 42 ],
  17995. "D": [ 357 ],
  17996. "E": [ 125 ],
  17997. "Q": [ 363 ]
  17998. }
  17999. },
  18000. "cache_I.ev_tag_r_SB_DFFE_Q_10": {
  18001. "hide_name": 0,
  18002. "type": "SB_DFFE",
  18003. "parameters": {
  18004. },
  18005. "attributes": {
  18006. "module_not_derived": "00000000000000000000000000000001",
  18007. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18008. },
  18009. "port_directions": {
  18010. "C": "input",
  18011. "D": "input",
  18012. "E": "input",
  18013. "Q": "output"
  18014. },
  18015. "connections": {
  18016. "C": [ 42 ],
  18017. "D": [ 284 ],
  18018. "E": [ 125 ],
  18019. "Q": [ 364 ]
  18020. }
  18021. },
  18022. "cache_I.ev_tag_r_SB_DFFE_Q_11": {
  18023. "hide_name": 0,
  18024. "type": "SB_DFFE",
  18025. "parameters": {
  18026. },
  18027. "attributes": {
  18028. "module_not_derived": "00000000000000000000000000000001",
  18029. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18030. },
  18031. "port_directions": {
  18032. "C": "input",
  18033. "D": "input",
  18034. "E": "input",
  18035. "Q": "output"
  18036. },
  18037. "connections": {
  18038. "C": [ 42 ],
  18039. "D": [ 297 ],
  18040. "E": [ 125 ],
  18041. "Q": [ 365 ]
  18042. }
  18043. },
  18044. "cache_I.ev_tag_r_SB_DFFE_Q_2": {
  18045. "hide_name": 0,
  18046. "type": "SB_DFFE",
  18047. "parameters": {
  18048. },
  18049. "attributes": {
  18050. "module_not_derived": "00000000000000000000000000000001",
  18051. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18052. },
  18053. "port_directions": {
  18054. "C": "input",
  18055. "D": "input",
  18056. "E": "input",
  18057. "Q": "output"
  18058. },
  18059. "connections": {
  18060. "C": [ 42 ],
  18061. "D": [ 350 ],
  18062. "E": [ 125 ],
  18063. "Q": [ 366 ]
  18064. }
  18065. },
  18066. "cache_I.ev_tag_r_SB_DFFE_Q_3": {
  18067. "hide_name": 0,
  18068. "type": "SB_DFFE",
  18069. "parameters": {
  18070. },
  18071. "attributes": {
  18072. "module_not_derived": "00000000000000000000000000000001",
  18073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18074. },
  18075. "port_directions": {
  18076. "C": "input",
  18077. "D": "input",
  18078. "E": "input",
  18079. "Q": "output"
  18080. },
  18081. "connections": {
  18082. "C": [ 42 ],
  18083. "D": [ 343 ],
  18084. "E": [ 125 ],
  18085. "Q": [ 367 ]
  18086. }
  18087. },
  18088. "cache_I.ev_tag_r_SB_DFFE_Q_4": {
  18089. "hide_name": 0,
  18090. "type": "SB_DFFE",
  18091. "parameters": {
  18092. },
  18093. "attributes": {
  18094. "module_not_derived": "00000000000000000000000000000001",
  18095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18096. },
  18097. "port_directions": {
  18098. "C": "input",
  18099. "D": "input",
  18100. "E": "input",
  18101. "Q": "output"
  18102. },
  18103. "connections": {
  18104. "C": [ 42 ],
  18105. "D": [ 336 ],
  18106. "E": [ 125 ],
  18107. "Q": [ 368 ]
  18108. }
  18109. },
  18110. "cache_I.ev_tag_r_SB_DFFE_Q_5": {
  18111. "hide_name": 0,
  18112. "type": "SB_DFFE",
  18113. "parameters": {
  18114. },
  18115. "attributes": {
  18116. "module_not_derived": "00000000000000000000000000000001",
  18117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18118. },
  18119. "port_directions": {
  18120. "C": "input",
  18121. "D": "input",
  18122. "E": "input",
  18123. "Q": "output"
  18124. },
  18125. "connections": {
  18126. "C": [ 42 ],
  18127. "D": [ 329 ],
  18128. "E": [ 125 ],
  18129. "Q": [ 369 ]
  18130. }
  18131. },
  18132. "cache_I.ev_tag_r_SB_DFFE_Q_6": {
  18133. "hide_name": 0,
  18134. "type": "SB_DFFE",
  18135. "parameters": {
  18136. },
  18137. "attributes": {
  18138. "module_not_derived": "00000000000000000000000000000001",
  18139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18140. },
  18141. "port_directions": {
  18142. "C": "input",
  18143. "D": "input",
  18144. "E": "input",
  18145. "Q": "output"
  18146. },
  18147. "connections": {
  18148. "C": [ 42 ],
  18149. "D": [ 322 ],
  18150. "E": [ 125 ],
  18151. "Q": [ 370 ]
  18152. }
  18153. },
  18154. "cache_I.ev_tag_r_SB_DFFE_Q_7": {
  18155. "hide_name": 0,
  18156. "type": "SB_DFFE",
  18157. "parameters": {
  18158. },
  18159. "attributes": {
  18160. "module_not_derived": "00000000000000000000000000000001",
  18161. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18162. },
  18163. "port_directions": {
  18164. "C": "input",
  18165. "D": "input",
  18166. "E": "input",
  18167. "Q": "output"
  18168. },
  18169. "connections": {
  18170. "C": [ 42 ],
  18171. "D": [ 315 ],
  18172. "E": [ 125 ],
  18173. "Q": [ 371 ]
  18174. }
  18175. },
  18176. "cache_I.ev_tag_r_SB_DFFE_Q_8": {
  18177. "hide_name": 0,
  18178. "type": "SB_DFFE",
  18179. "parameters": {
  18180. },
  18181. "attributes": {
  18182. "module_not_derived": "00000000000000000000000000000001",
  18183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18184. },
  18185. "port_directions": {
  18186. "C": "input",
  18187. "D": "input",
  18188. "E": "input",
  18189. "Q": "output"
  18190. },
  18191. "connections": {
  18192. "C": [ 42 ],
  18193. "D": [ 309 ],
  18194. "E": [ 125 ],
  18195. "Q": [ 372 ]
  18196. }
  18197. },
  18198. "cache_I.ev_tag_r_SB_DFFE_Q_9": {
  18199. "hide_name": 0,
  18200. "type": "SB_DFFE",
  18201. "parameters": {
  18202. },
  18203. "attributes": {
  18204. "module_not_derived": "00000000000000000000000000000001",
  18205. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18206. },
  18207. "port_directions": {
  18208. "C": "input",
  18209. "D": "input",
  18210. "E": "input",
  18211. "Q": "output"
  18212. },
  18213. "connections": {
  18214. "C": [ 42 ],
  18215. "D": [ 287 ],
  18216. "E": [ 125 ],
  18217. "Q": [ 373 ]
  18218. }
  18219. },
  18220. "cache_I.ev_valid_SB_LUT4_O": {
  18221. "hide_name": 0,
  18222. "type": "SB_LUT4",
  18223. "parameters": {
  18224. "LUT_INIT": "1110110011111111"
  18225. },
  18226. "attributes": {
  18227. "module_not_derived": "00000000000000000000000000000001",
  18228. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18229. },
  18230. "port_directions": {
  18231. "I0": "input",
  18232. "I1": "input",
  18233. "I2": "input",
  18234. "I3": "input",
  18235. "O": "output"
  18236. },
  18237. "connections": {
  18238. "I0": [ 374 ],
  18239. "I1": [ 375 ],
  18240. "I2": [ 147 ],
  18241. "I3": [ 376 ],
  18242. "O": [ 377 ]
  18243. }
  18244. },
  18245. "cache_I.ev_valid_SB_LUT4_O_I1_SB_LUT4_O": {
  18246. "hide_name": 0,
  18247. "type": "SB_LUT4",
  18248. "parameters": {
  18249. "LUT_INIT": "0001001101011111"
  18250. },
  18251. "attributes": {
  18252. "module_not_derived": "00000000000000000000000000000001",
  18253. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18254. },
  18255. "port_directions": {
  18256. "I0": "input",
  18257. "I1": "input",
  18258. "I2": "input",
  18259. "I3": "input",
  18260. "O": "output"
  18261. },
  18262. "connections": {
  18263. "I0": [ 378 ],
  18264. "I1": [ 379 ],
  18265. "I2": [ 141 ],
  18266. "I3": [ 148 ],
  18267. "O": [ 376 ]
  18268. }
  18269. },
  18270. "cache_I.ev_valid_SB_LUT4_O_I1_SB_LUT4_O_1": {
  18271. "hide_name": 0,
  18272. "type": "SB_LUT4",
  18273. "parameters": {
  18274. "LUT_INIT": "1100000000000000"
  18275. },
  18276. "attributes": {
  18277. "module_not_derived": "00000000000000000000000000000001",
  18278. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  18279. },
  18280. "port_directions": {
  18281. "I0": "input",
  18282. "I1": "input",
  18283. "I2": "input",
  18284. "I3": "input",
  18285. "O": "output"
  18286. },
  18287. "connections": {
  18288. "I0": [ "0" ],
  18289. "I1": [ 380 ],
  18290. "I2": [ 381 ],
  18291. "I3": [ 382 ],
  18292. "O": [ 375 ]
  18293. }
  18294. },
  18295. "cache_I.ev_valid_r_SB_DFFE_Q": {
  18296. "hide_name": 0,
  18297. "type": "SB_DFFE",
  18298. "parameters": {
  18299. },
  18300. "attributes": {
  18301. "module_not_derived": "00000000000000000000000000000001",
  18302. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18303. },
  18304. "port_directions": {
  18305. "C": "input",
  18306. "D": "input",
  18307. "E": "input",
  18308. "Q": "output"
  18309. },
  18310. "connections": {
  18311. "C": [ 42 ],
  18312. "D": [ 377 ],
  18313. "E": [ 125 ],
  18314. "Q": [ 383 ]
  18315. }
  18316. },
  18317. "cache_I.ev_way_SB_LUT4_I3": {
  18318. "hide_name": 0,
  18319. "type": "SB_LUT4",
  18320. "parameters": {
  18321. "LUT_INIT": "0000000001110000"
  18322. },
  18323. "attributes": {
  18324. "module_not_derived": "00000000000000000000000000000001",
  18325. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18326. },
  18327. "port_directions": {
  18328. "I0": "input",
  18329. "I1": "input",
  18330. "I2": "input",
  18331. "I3": "input",
  18332. "O": "output"
  18333. },
  18334. "connections": {
  18335. "I0": [ 384 ],
  18336. "I1": [ 385 ],
  18337. "I2": [ 379 ],
  18338. "I3": [ 386 ],
  18339. "O": [ 141 ]
  18340. }
  18341. },
  18342. "cache_I.ev_way_SB_LUT4_I3_1": {
  18343. "hide_name": 0,
  18344. "type": "SB_LUT4",
  18345. "parameters": {
  18346. "LUT_INIT": "0000000010001111"
  18347. },
  18348. "attributes": {
  18349. "module_not_derived": "00000000000000000000000000000001",
  18350. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18351. },
  18352. "port_directions": {
  18353. "I0": "input",
  18354. "I1": "input",
  18355. "I2": "input",
  18356. "I3": "input",
  18357. "O": "output"
  18358. },
  18359. "connections": {
  18360. "I0": [ 384 ],
  18361. "I1": [ 385 ],
  18362. "I2": [ 379 ],
  18363. "I3": [ 386 ],
  18364. "O": [ 148 ]
  18365. }
  18366. },
  18367. "cache_I.ev_way_SB_LUT4_I3_1_O_SB_LUT4_O": {
  18368. "hide_name": 0,
  18369. "type": "SB_LUT4",
  18370. "parameters": {
  18371. "LUT_INIT": "0001010100111111"
  18372. },
  18373. "attributes": {
  18374. "module_not_derived": "00000000000000000000000000000001",
  18375. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18376. },
  18377. "port_directions": {
  18378. "I0": "input",
  18379. "I1": "input",
  18380. "I2": "input",
  18381. "I3": "input",
  18382. "O": "output"
  18383. },
  18384. "connections": {
  18385. "I0": [ 387 ],
  18386. "I1": [ 388 ],
  18387. "I2": [ 147 ],
  18388. "I3": [ 141 ],
  18389. "O": [ 283 ]
  18390. }
  18391. },
  18392. "cache_I.ev_way_SB_LUT4_I3_1_O_SB_LUT4_O_1": {
  18393. "hide_name": 0,
  18394. "type": "SB_LUT4",
  18395. "parameters": {
  18396. "LUT_INIT": "0000000011110000"
  18397. },
  18398. "attributes": {
  18399. "module_not_derived": "00000000000000000000000000000001",
  18400. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  18401. },
  18402. "port_directions": {
  18403. "I0": "input",
  18404. "I1": "input",
  18405. "I2": "input",
  18406. "I3": "input",
  18407. "O": "output"
  18408. },
  18409. "connections": {
  18410. "I0": [ "0" ],
  18411. "I1": [ "0" ],
  18412. "I2": [ 389 ],
  18413. "I3": [ 144 ],
  18414. "O": [ 282 ]
  18415. }
  18416. },
  18417. "cache_I.ev_way_SB_LUT4_I3_O_SB_LUT4_O": {
  18418. "hide_name": 0,
  18419. "type": "SB_LUT4",
  18420. "parameters": {
  18421. "LUT_INIT": "1000111100000000"
  18422. },
  18423. "attributes": {
  18424. "module_not_derived": "00000000000000000000000000000001",
  18425. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18426. },
  18427. "port_directions": {
  18428. "I0": "input",
  18429. "I1": "input",
  18430. "I2": "input",
  18431. "I3": "input",
  18432. "O": "output"
  18433. },
  18434. "connections": {
  18435. "I0": [ 390 ],
  18436. "I1": [ 391 ],
  18437. "I2": [ 374 ],
  18438. "I3": [ 144 ],
  18439. "O": [ 147 ]
  18440. }
  18441. },
  18442. "cache_I.ev_way_SB_LUT4_O": {
  18443. "hide_name": 0,
  18444. "type": "SB_LUT4",
  18445. "parameters": {
  18446. "LUT_INIT": "1000111111111111"
  18447. },
  18448. "attributes": {
  18449. "module_not_derived": "00000000000000000000000000000001",
  18450. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18451. },
  18452. "port_directions": {
  18453. "I0": "input",
  18454. "I1": "input",
  18455. "I2": "input",
  18456. "I3": "input",
  18457. "O": "output"
  18458. },
  18459. "connections": {
  18460. "I0": [ 390 ],
  18461. "I1": [ 391 ],
  18462. "I2": [ 374 ],
  18463. "I3": [ 144 ],
  18464. "O": [ 386 ]
  18465. }
  18466. },
  18467. "cache_I.ev_way_SB_LUT4_O_1": {
  18468. "hide_name": 0,
  18469. "type": "SB_LUT4",
  18470. "parameters": {
  18471. "LUT_INIT": "0000000000001111"
  18472. },
  18473. "attributes": {
  18474. "module_not_derived": "00000000000000000000000000000001",
  18475. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  18476. },
  18477. "port_directions": {
  18478. "I0": "input",
  18479. "I1": "input",
  18480. "I2": "input",
  18481. "I3": "input",
  18482. "O": "output"
  18483. },
  18484. "connections": {
  18485. "I0": [ "0" ],
  18486. "I1": [ "0" ],
  18487. "I2": [ 392 ],
  18488. "I3": [ 147 ],
  18489. "O": [ 393 ]
  18490. }
  18491. },
  18492. "cache_I.ev_way_SB_LUT4_O_1_I2_SB_LUT4_O": {
  18493. "hide_name": 0,
  18494. "type": "SB_LUT4",
  18495. "parameters": {
  18496. "LUT_INIT": "0111000000000000"
  18497. },
  18498. "attributes": {
  18499. "module_not_derived": "00000000000000000000000000000001",
  18500. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18501. },
  18502. "port_directions": {
  18503. "I0": "input",
  18504. "I1": "input",
  18505. "I2": "input",
  18506. "I3": "input",
  18507. "O": "output"
  18508. },
  18509. "connections": {
  18510. "I0": [ 384 ],
  18511. "I1": [ 385 ],
  18512. "I2": [ 379 ],
  18513. "I3": [ 144 ],
  18514. "O": [ 392 ]
  18515. }
  18516. },
  18517. "cache_I.ev_way_SB_LUT4_O_I3_SB_LUT4_O": {
  18518. "hide_name": 0,
  18519. "type": "SB_LUT4",
  18520. "parameters": {
  18521. "LUT_INIT": "0011000011110000"
  18522. },
  18523. "attributes": {
  18524. "module_not_derived": "00000000000000000000000000000001",
  18525. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  18526. },
  18527. "port_directions": {
  18528. "I0": "input",
  18529. "I1": "input",
  18530. "I2": "input",
  18531. "I3": "input",
  18532. "O": "output"
  18533. },
  18534. "connections": {
  18535. "I0": [ "0" ],
  18536. "I1": [ 380 ],
  18537. "I2": [ 381 ],
  18538. "I3": [ 382 ],
  18539. "O": [ 144 ]
  18540. }
  18541. },
  18542. "cache_I.ev_way_r_SB_DFFE_Q": {
  18543. "hide_name": 0,
  18544. "type": "SB_DFFE",
  18545. "parameters": {
  18546. },
  18547. "attributes": {
  18548. "module_not_derived": "00000000000000000000000000000001",
  18549. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18550. },
  18551. "port_directions": {
  18552. "C": "input",
  18553. "D": "input",
  18554. "E": "input",
  18555. "Q": "output"
  18556. },
  18557. "connections": {
  18558. "C": [ 42 ],
  18559. "D": [ 386 ],
  18560. "E": [ 125 ],
  18561. "Q": [ 209 ]
  18562. }
  18563. },
  18564. "cache_I.ev_way_r_SB_DFFE_Q_1": {
  18565. "hide_name": 0,
  18566. "type": "SB_DFFE",
  18567. "parameters": {
  18568. },
  18569. "attributes": {
  18570. "module_not_derived": "00000000000000000000000000000001",
  18571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:347.2-354.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  18572. },
  18573. "port_directions": {
  18574. "C": "input",
  18575. "D": "input",
  18576. "E": "input",
  18577. "Q": "output"
  18578. },
  18579. "connections": {
  18580. "C": [ 42 ],
  18581. "D": [ 393 ],
  18582. "E": [ 125 ],
  18583. "Q": [ 201 ]
  18584. }
  18585. },
  18586. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  18587. "hide_name": 0,
  18588. "type": "SB_RAM40_4KNW",
  18589. "parameters": {
  18590. "READ_MODE": "00000000000000000000000000000001",
  18591. "WRITE_MODE": "00000000000000000000000000000000"
  18592. },
  18593. "attributes": {
  18594. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I genblk2.genblk1.genblk1.ebr_I",
  18595. "module_not_derived": "00000000000000000000000000000001",
  18596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  18597. },
  18598. "port_directions": {
  18599. "MASK": "input",
  18600. "RADDR": "input",
  18601. "RCLK": "input",
  18602. "RCLKE": "input",
  18603. "RDATA": "output",
  18604. "RE": "input",
  18605. "WADDR": "input",
  18606. "WCLKE": "input",
  18607. "WCLKN": "input",
  18608. "WDATA": "input",
  18609. "WE": "input"
  18610. },
  18611. "connections": {
  18612. "MASK": [ 394, 395, 394, 395, 394, 395, 394, 395, 394, 395, 394, 395, 394, 395, 394, 395 ],
  18613. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  18614. "RCLK": [ 42 ],
  18615. "RCLKE": [ 400 ],
  18616. "RDATA": [ 300, 401, 319, 402, 302, 403, 330, 404, 387, 405, 326, 406, 310, 407, 339, 408 ],
  18617. "RE": [ "1" ],
  18618. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  18619. "WCLKE": [ 417 ],
  18620. "WCLKN": [ 42 ],
  18621. "WDATA": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  18622. "WE": [ "1" ]
  18623. }
  18624. },
  18625. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.rd_ena_SB_LUT4_O": {
  18626. "hide_name": 0,
  18627. "type": "SB_LUT4",
  18628. "parameters": {
  18629. "LUT_INIT": "0000000000001111"
  18630. },
  18631. "attributes": {
  18632. "module_not_derived": "00000000000000000000000000000001",
  18633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  18634. },
  18635. "port_directions": {
  18636. "I0": "input",
  18637. "I1": "input",
  18638. "I2": "input",
  18639. "I3": "input",
  18640. "O": "output"
  18641. },
  18642. "connections": {
  18643. "I0": [ "0" ],
  18644. "I1": [ "0" ],
  18645. "I2": [ 128 ],
  18646. "I3": [ 126 ],
  18647. "O": [ 400 ]
  18648. }
  18649. },
  18650. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  18651. "hide_name": 0,
  18652. "type": "SB_RAM40_4KNW",
  18653. "parameters": {
  18654. "READ_MODE": "00000000000000000000000000000001",
  18655. "WRITE_MODE": "00000000000000000000000000000000"
  18656. },
  18657. "attributes": {
  18658. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I genblk2.genblk1.genblk1.ebr_I",
  18659. "module_not_derived": "00000000000000000000000000000001",
  18660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  18661. },
  18662. "port_directions": {
  18663. "MASK": "input",
  18664. "RADDR": "input",
  18665. "RCLK": "input",
  18666. "RCLKE": "input",
  18667. "RDATA": "output",
  18668. "RE": "input",
  18669. "WADDR": "input",
  18670. "WCLKE": "input",
  18671. "WCLKN": "input",
  18672. "WDATA": "input",
  18673. "WE": "input"
  18674. },
  18675. "connections": {
  18676. "MASK": [ 394, 395, 426, 427, 394, 395, 428, 429, 394, 395, 426, 427, 394, 395, 430, 431 ],
  18677. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  18678. "RCLK": [ 42 ],
  18679. "RCLKE": [ 400 ],
  18680. "RDATA": [ 346, 432, 433, 434, 360, 435, 139, 436, 352, 437, 438, 439, 291, 440, 378, 441 ],
  18681. "RE": [ "1" ],
  18682. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  18683. "WCLKE": [ 417 ],
  18684. "WCLKN": [ 42 ],
  18685. "WDATA": [ 442, 442, 443, 443, 444, 444, 445, 445, 446, 446, 447, 447, 448, 448, 449, 449 ],
  18686. "WE": [ "1" ]
  18687. }
  18688. },
  18689. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q": {
  18690. "hide_name": 0,
  18691. "type": "SB_DFF",
  18692. "parameters": {
  18693. },
  18694. "attributes": {
  18695. "module_not_derived": "00000000000000000000000000000001",
  18696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18697. },
  18698. "port_directions": {
  18699. "C": "input",
  18700. "D": "input",
  18701. "Q": "output"
  18702. },
  18703. "connections": {
  18704. "C": [ 42 ],
  18705. "D": [ 160 ],
  18706. "Q": [ 416 ]
  18707. }
  18708. },
  18709. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_1": {
  18710. "hide_name": 0,
  18711. "type": "SB_DFF",
  18712. "parameters": {
  18713. },
  18714. "attributes": {
  18715. "module_not_derived": "00000000000000000000000000000001",
  18716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18717. },
  18718. "port_directions": {
  18719. "C": "input",
  18720. "D": "input",
  18721. "Q": "output"
  18722. },
  18723. "connections": {
  18724. "C": [ 42 ],
  18725. "D": [ 159 ],
  18726. "Q": [ 415 ]
  18727. }
  18728. },
  18729. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_2": {
  18730. "hide_name": 0,
  18731. "type": "SB_DFF",
  18732. "parameters": {
  18733. },
  18734. "attributes": {
  18735. "module_not_derived": "00000000000000000000000000000001",
  18736. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18737. },
  18738. "port_directions": {
  18739. "C": "input",
  18740. "D": "input",
  18741. "Q": "output"
  18742. },
  18743. "connections": {
  18744. "C": [ 42 ],
  18745. "D": [ 158 ],
  18746. "Q": [ 414 ]
  18747. }
  18748. },
  18749. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_3": {
  18750. "hide_name": 0,
  18751. "type": "SB_DFF",
  18752. "parameters": {
  18753. },
  18754. "attributes": {
  18755. "module_not_derived": "00000000000000000000000000000001",
  18756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18757. },
  18758. "port_directions": {
  18759. "C": "input",
  18760. "D": "input",
  18761. "Q": "output"
  18762. },
  18763. "connections": {
  18764. "C": [ 42 ],
  18765. "D": [ 157 ],
  18766. "Q": [ 413 ]
  18767. }
  18768. },
  18769. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_4": {
  18770. "hide_name": 0,
  18771. "type": "SB_DFF",
  18772. "parameters": {
  18773. },
  18774. "attributes": {
  18775. "module_not_derived": "00000000000000000000000000000001",
  18776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18777. },
  18778. "port_directions": {
  18779. "C": "input",
  18780. "D": "input",
  18781. "Q": "output"
  18782. },
  18783. "connections": {
  18784. "C": [ 42 ],
  18785. "D": [ 156 ],
  18786. "Q": [ 412 ]
  18787. }
  18788. },
  18789. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_5": {
  18790. "hide_name": 0,
  18791. "type": "SB_DFF",
  18792. "parameters": {
  18793. },
  18794. "attributes": {
  18795. "module_not_derived": "00000000000000000000000000000001",
  18796. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18797. },
  18798. "port_directions": {
  18799. "C": "input",
  18800. "D": "input",
  18801. "Q": "output"
  18802. },
  18803. "connections": {
  18804. "C": [ 42 ],
  18805. "D": [ 155 ],
  18806. "Q": [ 411 ]
  18807. }
  18808. },
  18809. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_6": {
  18810. "hide_name": 0,
  18811. "type": "SB_DFF",
  18812. "parameters": {
  18813. },
  18814. "attributes": {
  18815. "module_not_derived": "00000000000000000000000000000001",
  18816. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18817. },
  18818. "port_directions": {
  18819. "C": "input",
  18820. "D": "input",
  18821. "Q": "output"
  18822. },
  18823. "connections": {
  18824. "C": [ 42 ],
  18825. "D": [ 154 ],
  18826. "Q": [ 410 ]
  18827. }
  18828. },
  18829. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_7": {
  18830. "hide_name": 0,
  18831. "type": "SB_DFF",
  18832. "parameters": {
  18833. },
  18834. "attributes": {
  18835. "module_not_derived": "00000000000000000000000000000001",
  18836. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18837. },
  18838. "port_directions": {
  18839. "C": "input",
  18840. "D": "input",
  18841. "Q": "output"
  18842. },
  18843. "connections": {
  18844. "C": [ 42 ],
  18845. "D": [ 153 ],
  18846. "Q": [ 409 ]
  18847. }
  18848. },
  18849. "cache_I.genblk1[0].tag_ram_I.w_addr_r_SB_DFF_Q_8": {
  18850. "hide_name": 0,
  18851. "type": "SB_DFF",
  18852. "parameters": {
  18853. },
  18854. "attributes": {
  18855. "module_not_derived": "00000000000000000000000000000001",
  18856. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  18857. },
  18858. "port_directions": {
  18859. "C": "input",
  18860. "D": "input",
  18861. "Q": "output"
  18862. },
  18863. "connections": {
  18864. "C": [ 42 ],
  18865. "D": [ 152 ],
  18866. "Q": [ 426 ]
  18867. }
  18868. },
  18869. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O": {
  18870. "hide_name": 0,
  18871. "type": "SB_LUT4",
  18872. "parameters": {
  18873. "LUT_INIT": "1111110101110101"
  18874. },
  18875. "attributes": {
  18876. "module_not_derived": "00000000000000000000000000000001",
  18877. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18878. },
  18879. "port_directions": {
  18880. "I0": "input",
  18881. "I1": "input",
  18882. "I2": "input",
  18883. "I3": "input",
  18884. "O": "output"
  18885. },
  18886. "connections": {
  18887. "I0": [ 378 ],
  18888. "I1": [ 125 ],
  18889. "I2": [ 450 ],
  18890. "I3": [ 451 ],
  18891. "O": [ 452 ]
  18892. }
  18893. },
  18894. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1": {
  18895. "hide_name": 0,
  18896. "type": "SB_LUT4",
  18897. "parameters": {
  18898. "LUT_INIT": "1111011111010101"
  18899. },
  18900. "attributes": {
  18901. "module_not_derived": "00000000000000000000000000000001",
  18902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18903. },
  18904. "port_directions": {
  18905. "I0": "input",
  18906. "I1": "input",
  18907. "I2": "input",
  18908. "I3": "input",
  18909. "O": "output"
  18910. },
  18911. "connections": {
  18912. "I0": [ 378 ],
  18913. "I1": [ 121 ],
  18914. "I2": [ 453 ],
  18915. "I3": [ 454 ],
  18916. "O": [ 455 ]
  18917. }
  18918. },
  18919. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O": {
  18920. "hide_name": 0,
  18921. "type": "SB_LUT4",
  18922. "parameters": {
  18923. "LUT_INIT": "0000000000111100"
  18924. },
  18925. "attributes": {
  18926. "module_not_derived": "00000000000000000000000000000001",
  18927. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  18928. },
  18929. "port_directions": {
  18930. "I0": "input",
  18931. "I1": "input",
  18932. "I2": "input",
  18933. "I3": "input",
  18934. "O": "output"
  18935. },
  18936. "connections": {
  18937. "I0": [ "0" ],
  18938. "I1": [ 433 ],
  18939. "I2": [ 383 ],
  18940. "I3": [ 456 ],
  18941. "O": [ 453 ]
  18942. }
  18943. },
  18944. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  18945. "hide_name": 0,
  18946. "type": "SB_LUT4",
  18947. "parameters": {
  18948. "LUT_INIT": "0001001100010010"
  18949. },
  18950. "attributes": {
  18951. "module_not_derived": "00000000000000000000000000000001",
  18952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  18953. },
  18954. "port_directions": {
  18955. "I0": "input",
  18956. "I1": "input",
  18957. "I2": "input",
  18958. "I3": "input",
  18959. "O": "output"
  18960. },
  18961. "connections": {
  18962. "I0": [ 433 ],
  18963. "I1": [ 457 ],
  18964. "I2": [ 458 ],
  18965. "I3": [ 459 ],
  18966. "O": [ 454 ]
  18967. }
  18968. },
  18969. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  18970. "hide_name": 0,
  18971. "type": "SB_LUT4",
  18972. "parameters": {
  18973. "LUT_INIT": "0000001100001111"
  18974. },
  18975. "attributes": {
  18976. "module_not_derived": "00000000000000000000000000000001",
  18977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  18978. },
  18979. "port_directions": {
  18980. "I0": "input",
  18981. "I1": "input",
  18982. "I2": "input",
  18983. "I3": "input",
  18984. "O": "output"
  18985. },
  18986. "connections": {
  18987. "I0": [ "0" ],
  18988. "I1": [ 438 ],
  18989. "I2": [ 460 ],
  18990. "I3": [ 461 ],
  18991. "O": [ 459 ]
  18992. }
  18993. },
  18994. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  18995. "hide_name": 0,
  18996. "type": "SB_LUT4",
  18997. "parameters": {
  18998. "LUT_INIT": "0000000000001111"
  18999. },
  19000. "attributes": {
  19001. "module_not_derived": "00000000000000000000000000000001",
  19002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19003. },
  19004. "port_directions": {
  19005. "I0": "input",
  19006. "I1": "input",
  19007. "I2": "input",
  19008. "I3": "input",
  19009. "O": "output"
  19010. },
  19011. "connections": {
  19012. "I0": [ "0" ],
  19013. "I1": [ "0" ],
  19014. "I2": [ 438 ],
  19015. "I3": [ 462 ],
  19016. "O": [ 458 ]
  19017. }
  19018. },
  19019. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O": {
  19020. "hide_name": 0,
  19021. "type": "SB_LUT4",
  19022. "parameters": {
  19023. "LUT_INIT": "0000101000001110"
  19024. },
  19025. "attributes": {
  19026. "module_not_derived": "00000000000000000000000000000001",
  19027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19028. },
  19029. "port_directions": {
  19030. "I0": "input",
  19031. "I1": "input",
  19032. "I2": "input",
  19033. "I3": "input",
  19034. "O": "output"
  19035. },
  19036. "connections": {
  19037. "I0": [ 438 ],
  19038. "I1": [ 433 ],
  19039. "I2": [ 457 ],
  19040. "I3": [ 462 ],
  19041. "O": [ 451 ]
  19042. }
  19043. },
  19044. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O_1": {
  19045. "hide_name": 0,
  19046. "type": "SB_LUT4",
  19047. "parameters": {
  19048. "LUT_INIT": "0000000001101010"
  19049. },
  19050. "attributes": {
  19051. "module_not_derived": "00000000000000000000000000000001",
  19052. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19053. },
  19054. "port_directions": {
  19055. "I0": "input",
  19056. "I1": "input",
  19057. "I2": "input",
  19058. "I3": "input",
  19059. "O": "output"
  19060. },
  19061. "connections": {
  19062. "I0": [ 438 ],
  19063. "I1": [ 433 ],
  19064. "I2": [ 383 ],
  19065. "I3": [ 456 ],
  19066. "O": [ 450 ]
  19067. }
  19068. },
  19069. "cache_I.genblk1[0].tag_ram_I.w_ena_SB_LUT4_O": {
  19070. "hide_name": 0,
  19071. "type": "SB_LUT4",
  19072. "parameters": {
  19073. "LUT_INIT": "1111111111110000"
  19074. },
  19075. "attributes": {
  19076. "module_not_derived": "00000000000000000000000000000001",
  19077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19078. },
  19079. "port_directions": {
  19080. "I0": "input",
  19081. "I1": "input",
  19082. "I2": "input",
  19083. "I3": "input",
  19084. "O": "output"
  19085. },
  19086. "connections": {
  19087. "I0": [ "0" ],
  19088. "I1": [ "0" ],
  19089. "I2": [ 463 ],
  19090. "I3": [ 464 ],
  19091. "O": [ 465 ]
  19092. }
  19093. },
  19094. "cache_I.genblk1[0].tag_ram_I.w_ena_r_SB_DFF_Q": {
  19095. "hide_name": 0,
  19096. "type": "SB_DFF",
  19097. "parameters": {
  19098. },
  19099. "attributes": {
  19100. "module_not_derived": "00000000000000000000000000000001",
  19101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19102. },
  19103. "port_directions": {
  19104. "C": "input",
  19105. "D": "input",
  19106. "Q": "output"
  19107. },
  19108. "connections": {
  19109. "C": [ 42 ],
  19110. "D": [ 465 ],
  19111. "Q": [ 417 ]
  19112. }
  19113. },
  19114. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O": {
  19115. "hide_name": 0,
  19116. "type": "SB_LUT4",
  19117. "parameters": {
  19118. "LUT_INIT": "1111001111111111"
  19119. },
  19120. "attributes": {
  19121. "module_not_derived": "00000000000000000000000000000001",
  19122. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  19123. },
  19124. "port_directions": {
  19125. "I0": "input",
  19126. "I1": "input",
  19127. "I2": "input",
  19128. "I3": "input",
  19129. "O": "output"
  19130. },
  19131. "connections": {
  19132. "I0": [ "0" ],
  19133. "I1": [ 123 ],
  19134. "I2": [ 124 ],
  19135. "I3": [ 456 ],
  19136. "O": [ 466 ]
  19137. }
  19138. },
  19139. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O_1": {
  19140. "hide_name": 0,
  19141. "type": "SB_LUT4",
  19142. "parameters": {
  19143. "LUT_INIT": "1111111100001111"
  19144. },
  19145. "attributes": {
  19146. "module_not_derived": "00000000000000000000000000000001",
  19147. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19148. },
  19149. "port_directions": {
  19150. "I0": "input",
  19151. "I1": "input",
  19152. "I2": "input",
  19153. "I3": "input",
  19154. "O": "output"
  19155. },
  19156. "connections": {
  19157. "I0": [ "0" ],
  19158. "I1": [ "0" ],
  19159. "I2": [ 456 ],
  19160. "I3": [ 125 ],
  19161. "O": [ 467 ]
  19162. }
  19163. },
  19164. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O_2": {
  19165. "hide_name": 0,
  19166. "type": "SB_LUT4",
  19167. "parameters": {
  19168. "LUT_INIT": "0011010100111111"
  19169. },
  19170. "attributes": {
  19171. "module_not_derived": "00000000000000000000000000000001",
  19172. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19173. },
  19174. "port_directions": {
  19175. "I0": "input",
  19176. "I1": "input",
  19177. "I2": "input",
  19178. "I3": "input",
  19179. "O": "output"
  19180. },
  19181. "connections": {
  19182. "I0": [ 457 ],
  19183. "I1": [ 456 ],
  19184. "I2": [ 121 ],
  19185. "I3": [ 231 ],
  19186. "O": [ 468 ]
  19187. }
  19188. },
  19189. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O_2_I3_SB_LUT4_O": {
  19190. "hide_name": 0,
  19191. "type": "SB_LUT4",
  19192. "parameters": {
  19193. "LUT_INIT": "0000000011000000"
  19194. },
  19195. "attributes": {
  19196. "module_not_derived": "00000000000000000000000000000001",
  19197. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  19198. },
  19199. "port_directions": {
  19200. "I0": "input",
  19201. "I1": "input",
  19202. "I2": "input",
  19203. "I3": "input",
  19204. "O": "output"
  19205. },
  19206. "connections": {
  19207. "I0": [ "0" ],
  19208. "I1": [ 469 ],
  19209. "I2": [ 470 ],
  19210. "I3": [ 135 ],
  19211. "O": [ 231 ]
  19212. }
  19213. },
  19214. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O_I3_SB_LUT4_O": {
  19215. "hide_name": 0,
  19216. "type": "SB_LUT4",
  19217. "parameters": {
  19218. "LUT_INIT": "0000000000001111"
  19219. },
  19220. "attributes": {
  19221. "module_not_derived": "00000000000000000000000000000001",
  19222. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19223. },
  19224. "port_directions": {
  19225. "I0": "input",
  19226. "I1": "input",
  19227. "I2": "input",
  19228. "I3": "input",
  19229. "O": "output"
  19230. },
  19231. "connections": {
  19232. "I0": [ "0" ],
  19233. "I1": [ "0" ],
  19234. "I2": [ 209 ],
  19235. "I3": [ 201 ],
  19236. "O": [ 456 ]
  19237. }
  19238. },
  19239. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_DFF_Q": {
  19240. "hide_name": 0,
  19241. "type": "SB_DFF",
  19242. "parameters": {
  19243. },
  19244. "attributes": {
  19245. "module_not_derived": "00000000000000000000000000000001",
  19246. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19247. },
  19248. "port_directions": {
  19249. "C": "input",
  19250. "D": "input",
  19251. "Q": "output"
  19252. },
  19253. "connections": {
  19254. "C": [ 42 ],
  19255. "D": [ 467 ],
  19256. "Q": [ 471 ]
  19257. }
  19258. },
  19259. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_DFF_Q_1": {
  19260. "hide_name": 0,
  19261. "type": "SB_DFF",
  19262. "parameters": {
  19263. },
  19264. "attributes": {
  19265. "module_not_derived": "00000000000000000000000000000001",
  19266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19267. },
  19268. "port_directions": {
  19269. "C": "input",
  19270. "D": "input",
  19271. "Q": "output"
  19272. },
  19273. "connections": {
  19274. "C": [ 42 ],
  19275. "D": [ 468 ],
  19276. "Q": [ 472 ]
  19277. }
  19278. },
  19279. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_DFF_Q_2": {
  19280. "hide_name": 0,
  19281. "type": "SB_DFF",
  19282. "parameters": {
  19283. },
  19284. "attributes": {
  19285. "module_not_derived": "00000000000000000000000000000001",
  19286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19287. },
  19288. "port_directions": {
  19289. "C": "input",
  19290. "D": "input",
  19291. "Q": "output"
  19292. },
  19293. "connections": {
  19294. "C": [ 42 ],
  19295. "D": [ 466 ],
  19296. "Q": [ 473 ]
  19297. }
  19298. },
  19299. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3": {
  19300. "hide_name": 0,
  19301. "type": "SB_LUT4",
  19302. "parameters": {
  19303. "LUT_INIT": "1111111100001111"
  19304. },
  19305. "attributes": {
  19306. "module_not_derived": "00000000000000000000000000000001",
  19307. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19308. },
  19309. "port_directions": {
  19310. "I0": "input",
  19311. "I1": "input",
  19312. "I2": "input",
  19313. "I3": "input",
  19314. "O": "output"
  19315. },
  19316. "connections": {
  19317. "I0": [ "0" ],
  19318. "I1": [ "0" ],
  19319. "I2": [ 426 ],
  19320. "I3": [ 473 ],
  19321. "O": [ 395 ]
  19322. }
  19323. },
  19324. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3_1": {
  19325. "hide_name": 0,
  19326. "type": "SB_LUT4",
  19327. "parameters": {
  19328. "LUT_INIT": "1111111111110000"
  19329. },
  19330. "attributes": {
  19331. "module_not_derived": "00000000000000000000000000000001",
  19332. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19333. },
  19334. "port_directions": {
  19335. "I0": "input",
  19336. "I1": "input",
  19337. "I2": "input",
  19338. "I3": "input",
  19339. "O": "output"
  19340. },
  19341. "connections": {
  19342. "I0": [ "0" ],
  19343. "I1": [ "0" ],
  19344. "I2": [ 426 ],
  19345. "I3": [ 473 ],
  19346. "O": [ 394 ]
  19347. }
  19348. },
  19349. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3_2": {
  19350. "hide_name": 0,
  19351. "type": "SB_LUT4",
  19352. "parameters": {
  19353. "LUT_INIT": "1111111100001111"
  19354. },
  19355. "attributes": {
  19356. "module_not_derived": "00000000000000000000000000000001",
  19357. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19358. },
  19359. "port_directions": {
  19360. "I0": "input",
  19361. "I1": "input",
  19362. "I2": "input",
  19363. "I3": "input",
  19364. "O": "output"
  19365. },
  19366. "connections": {
  19367. "I0": [ "0" ],
  19368. "I1": [ "0" ],
  19369. "I2": [ 426 ],
  19370. "I3": [ 471 ],
  19371. "O": [ 431 ]
  19372. }
  19373. },
  19374. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3_3": {
  19375. "hide_name": 0,
  19376. "type": "SB_LUT4",
  19377. "parameters": {
  19378. "LUT_INIT": "1111111111110000"
  19379. },
  19380. "attributes": {
  19381. "module_not_derived": "00000000000000000000000000000001",
  19382. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19383. },
  19384. "port_directions": {
  19385. "I0": "input",
  19386. "I1": "input",
  19387. "I2": "input",
  19388. "I3": "input",
  19389. "O": "output"
  19390. },
  19391. "connections": {
  19392. "I0": [ "0" ],
  19393. "I1": [ "0" ],
  19394. "I2": [ 426 ],
  19395. "I3": [ 471 ],
  19396. "O": [ 430 ]
  19397. }
  19398. },
  19399. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3_4": {
  19400. "hide_name": 0,
  19401. "type": "SB_LUT4",
  19402. "parameters": {
  19403. "LUT_INIT": "1111111100001111"
  19404. },
  19405. "attributes": {
  19406. "module_not_derived": "00000000000000000000000000000001",
  19407. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19408. },
  19409. "port_directions": {
  19410. "I0": "input",
  19411. "I1": "input",
  19412. "I2": "input",
  19413. "I3": "input",
  19414. "O": "output"
  19415. },
  19416. "connections": {
  19417. "I0": [ "0" ],
  19418. "I1": [ "0" ],
  19419. "I2": [ 426 ],
  19420. "I3": [ 472 ],
  19421. "O": [ 429 ]
  19422. }
  19423. },
  19424. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3_5": {
  19425. "hide_name": 0,
  19426. "type": "SB_LUT4",
  19427. "parameters": {
  19428. "LUT_INIT": "1111111111110000"
  19429. },
  19430. "attributes": {
  19431. "module_not_derived": "00000000000000000000000000000001",
  19432. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19433. },
  19434. "port_directions": {
  19435. "I0": "input",
  19436. "I1": "input",
  19437. "I2": "input",
  19438. "I3": "input",
  19439. "O": "output"
  19440. },
  19441. "connections": {
  19442. "I0": [ "0" ],
  19443. "I1": [ "0" ],
  19444. "I2": [ 426 ],
  19445. "I3": [ 472 ],
  19446. "O": [ 428 ]
  19447. }
  19448. },
  19449. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q": {
  19450. "hide_name": 0,
  19451. "type": "SB_DFF",
  19452. "parameters": {
  19453. },
  19454. "attributes": {
  19455. "module_not_derived": "00000000000000000000000000000001",
  19456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19457. },
  19458. "port_directions": {
  19459. "C": "input",
  19460. "D": "input",
  19461. "Q": "output"
  19462. },
  19463. "connections": {
  19464. "C": [ 42 ],
  19465. "D": [ 121 ],
  19466. "Q": [ 449 ]
  19467. }
  19468. },
  19469. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_1": {
  19470. "hide_name": 0,
  19471. "type": "SB_DFF",
  19472. "parameters": {
  19473. },
  19474. "attributes": {
  19475. "module_not_derived": "00000000000000000000000000000001",
  19476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19477. },
  19478. "port_directions": {
  19479. "C": "input",
  19480. "D": "input",
  19481. "Q": "output"
  19482. },
  19483. "connections": {
  19484. "C": [ 42 ],
  19485. "D": [ 125 ],
  19486. "Q": [ 445 ]
  19487. }
  19488. },
  19489. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_10": {
  19490. "hide_name": 0,
  19491. "type": "SB_DFF",
  19492. "parameters": {
  19493. },
  19494. "attributes": {
  19495. "module_not_derived": "00000000000000000000000000000001",
  19496. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19497. },
  19498. "port_directions": {
  19499. "C": "input",
  19500. "D": "input",
  19501. "Q": "output"
  19502. },
  19503. "connections": {
  19504. "C": [ 42 ],
  19505. "D": [ 474 ],
  19506. "Q": [ 423 ]
  19507. }
  19508. },
  19509. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_11": {
  19510. "hide_name": 0,
  19511. "type": "SB_DFF",
  19512. "parameters": {
  19513. },
  19514. "attributes": {
  19515. "module_not_derived": "00000000000000000000000000000001",
  19516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19517. },
  19518. "port_directions": {
  19519. "C": "input",
  19520. "D": "input",
  19521. "Q": "output"
  19522. },
  19523. "connections": {
  19524. "C": [ 42 ],
  19525. "D": [ 475 ],
  19526. "Q": [ 419 ]
  19527. }
  19528. },
  19529. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_12": {
  19530. "hide_name": 0,
  19531. "type": "SB_DFF",
  19532. "parameters": {
  19533. },
  19534. "attributes": {
  19535. "module_not_derived": "00000000000000000000000000000001",
  19536. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19537. },
  19538. "port_directions": {
  19539. "C": "input",
  19540. "D": "input",
  19541. "Q": "output"
  19542. },
  19543. "connections": {
  19544. "C": [ 42 ],
  19545. "D": [ 476 ],
  19546. "Q": [ 424 ]
  19547. }
  19548. },
  19549. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_13": {
  19550. "hide_name": 0,
  19551. "type": "SB_DFF",
  19552. "parameters": {
  19553. },
  19554. "attributes": {
  19555. "module_not_derived": "00000000000000000000000000000001",
  19556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19557. },
  19558. "port_directions": {
  19559. "C": "input",
  19560. "D": "input",
  19561. "Q": "output"
  19562. },
  19563. "connections": {
  19564. "C": [ 42 ],
  19565. "D": [ 477 ],
  19566. "Q": [ 420 ]
  19567. }
  19568. },
  19569. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_14": {
  19570. "hide_name": 0,
  19571. "type": "SB_DFF",
  19572. "parameters": {
  19573. },
  19574. "attributes": {
  19575. "module_not_derived": "00000000000000000000000000000001",
  19576. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19577. },
  19578. "port_directions": {
  19579. "C": "input",
  19580. "D": "input",
  19581. "Q": "output"
  19582. },
  19583. "connections": {
  19584. "C": [ 42 ],
  19585. "D": [ 478 ],
  19586. "Q": [ 422 ]
  19587. }
  19588. },
  19589. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_15": {
  19590. "hide_name": 0,
  19591. "type": "SB_DFF",
  19592. "parameters": {
  19593. },
  19594. "attributes": {
  19595. "module_not_derived": "00000000000000000000000000000001",
  19596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19597. },
  19598. "port_directions": {
  19599. "C": "input",
  19600. "D": "input",
  19601. "Q": "output"
  19602. },
  19603. "connections": {
  19604. "C": [ 42 ],
  19605. "D": [ 479 ],
  19606. "Q": [ 418 ]
  19607. }
  19608. },
  19609. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_2": {
  19610. "hide_name": 0,
  19611. "type": "SB_DFF",
  19612. "parameters": {
  19613. },
  19614. "attributes": {
  19615. "module_not_derived": "00000000000000000000000000000001",
  19616. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19617. },
  19618. "port_directions": {
  19619. "C": "input",
  19620. "D": "input",
  19621. "Q": "output"
  19622. },
  19623. "connections": {
  19624. "C": [ 42 ],
  19625. "D": [ 452 ],
  19626. "Q": [ 447 ]
  19627. }
  19628. },
  19629. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_3": {
  19630. "hide_name": 0,
  19631. "type": "SB_DFF",
  19632. "parameters": {
  19633. },
  19634. "attributes": {
  19635. "module_not_derived": "00000000000000000000000000000001",
  19636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19637. },
  19638. "port_directions": {
  19639. "C": "input",
  19640. "D": "input",
  19641. "Q": "output"
  19642. },
  19643. "connections": {
  19644. "C": [ 42 ],
  19645. "D": [ 455 ],
  19646. "Q": [ 443 ]
  19647. }
  19648. },
  19649. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_4": {
  19650. "hide_name": 0,
  19651. "type": "SB_DFF",
  19652. "parameters": {
  19653. },
  19654. "attributes": {
  19655. "module_not_derived": "00000000000000000000000000000001",
  19656. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19657. },
  19658. "port_directions": {
  19659. "C": "input",
  19660. "D": "input",
  19661. "Q": "output"
  19662. },
  19663. "connections": {
  19664. "C": [ 42 ],
  19665. "D": [ 480 ],
  19666. "Q": [ 448 ]
  19667. }
  19668. },
  19669. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_5": {
  19670. "hide_name": 0,
  19671. "type": "SB_DFF",
  19672. "parameters": {
  19673. },
  19674. "attributes": {
  19675. "module_not_derived": "00000000000000000000000000000001",
  19676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19677. },
  19678. "port_directions": {
  19679. "C": "input",
  19680. "D": "input",
  19681. "Q": "output"
  19682. },
  19683. "connections": {
  19684. "C": [ 42 ],
  19685. "D": [ 481 ],
  19686. "Q": [ 444 ]
  19687. }
  19688. },
  19689. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_6": {
  19690. "hide_name": 0,
  19691. "type": "SB_DFF",
  19692. "parameters": {
  19693. },
  19694. "attributes": {
  19695. "module_not_derived": "00000000000000000000000000000001",
  19696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19697. },
  19698. "port_directions": {
  19699. "C": "input",
  19700. "D": "input",
  19701. "Q": "output"
  19702. },
  19703. "connections": {
  19704. "C": [ 42 ],
  19705. "D": [ 482 ],
  19706. "Q": [ 446 ]
  19707. }
  19708. },
  19709. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_7": {
  19710. "hide_name": 0,
  19711. "type": "SB_DFF",
  19712. "parameters": {
  19713. },
  19714. "attributes": {
  19715. "module_not_derived": "00000000000000000000000000000001",
  19716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19717. },
  19718. "port_directions": {
  19719. "C": "input",
  19720. "D": "input",
  19721. "Q": "output"
  19722. },
  19723. "connections": {
  19724. "C": [ 42 ],
  19725. "D": [ 483 ],
  19726. "Q": [ 442 ]
  19727. }
  19728. },
  19729. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_8": {
  19730. "hide_name": 0,
  19731. "type": "SB_DFF",
  19732. "parameters": {
  19733. },
  19734. "attributes": {
  19735. "module_not_derived": "00000000000000000000000000000001",
  19736. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19737. },
  19738. "port_directions": {
  19739. "C": "input",
  19740. "D": "input",
  19741. "Q": "output"
  19742. },
  19743. "connections": {
  19744. "C": [ 42 ],
  19745. "D": [ 484 ],
  19746. "Q": [ 425 ]
  19747. }
  19748. },
  19749. "cache_I.genblk1[0].tag_ram_I.w_val_r_SB_DFF_Q_9": {
  19750. "hide_name": 0,
  19751. "type": "SB_DFF",
  19752. "parameters": {
  19753. },
  19754. "attributes": {
  19755. "module_not_derived": "00000000000000000000000000000001",
  19756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  19757. },
  19758. "port_directions": {
  19759. "C": "input",
  19760. "D": "input",
  19761. "Q": "output"
  19762. },
  19763. "connections": {
  19764. "C": [ 42 ],
  19765. "D": [ 485 ],
  19766. "Q": [ 421 ]
  19767. }
  19768. },
  19769. "cache_I.genblk1[0].tag_ram_I.w_valid_SB_LUT4_O": {
  19770. "hide_name": 0,
  19771. "type": "SB_LUT4",
  19772. "parameters": {
  19773. "LUT_INIT": "1111111111110000"
  19774. },
  19775. "attributes": {
  19776. "module_not_derived": "00000000000000000000000000000001",
  19777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  19778. },
  19779. "port_directions": {
  19780. "I0": "input",
  19781. "I1": "input",
  19782. "I2": "input",
  19783. "I3": "input",
  19784. "O": "output"
  19785. },
  19786. "connections": {
  19787. "I0": [ "0" ],
  19788. "I1": [ "0" ],
  19789. "I2": [ 123 ],
  19790. "I3": [ 124 ],
  19791. "O": [ 121 ]
  19792. }
  19793. },
  19794. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  19795. "hide_name": 0,
  19796. "type": "SB_RAM40_4KNW",
  19797. "parameters": {
  19798. "READ_MODE": "00000000000000000000000000000001",
  19799. "WRITE_MODE": "00000000000000000000000000000000"
  19800. },
  19801. "attributes": {
  19802. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I genblk2.genblk1.genblk1.ebr_I",
  19803. "module_not_derived": "00000000000000000000000000000001",
  19804. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  19805. },
  19806. "port_directions": {
  19807. "MASK": "input",
  19808. "RADDR": "input",
  19809. "RCLK": "input",
  19810. "RCLKE": "input",
  19811. "RDATA": "output",
  19812. "RE": "input",
  19813. "WADDR": "input",
  19814. "WCLKE": "input",
  19815. "WCLKN": "input",
  19816. "WDATA": "input",
  19817. "WE": "input"
  19818. },
  19819. "connections": {
  19820. "MASK": [ 486, 487, 486, 487, 486, 487, 486, 487, 486, 487, 486, 487, 486, 487, 486, 487 ],
  19821. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  19822. "RCLK": [ 42 ],
  19823. "RCLKE": [ 400 ],
  19824. "RDATA": [ 298, 488, 317, 489, 304, 490, 333, 491, 281, 492, 324, 493, 306, 494, 338, 495 ],
  19825. "RE": [ "1" ],
  19826. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  19827. "WCLKE": [ 417 ],
  19828. "WCLKN": [ 42 ],
  19829. "WDATA": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  19830. "WE": [ "1" ]
  19831. }
  19832. },
  19833. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  19834. "hide_name": 0,
  19835. "type": "SB_RAM40_4KNW",
  19836. "parameters": {
  19837. "READ_MODE": "00000000000000000000000000000001",
  19838. "WRITE_MODE": "00000000000000000000000000000000"
  19839. },
  19840. "attributes": {
  19841. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I genblk2.genblk1.genblk1.ebr_I",
  19842. "module_not_derived": "00000000000000000000000000000001",
  19843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  19844. },
  19845. "port_directions": {
  19846. "MASK": "input",
  19847. "RADDR": "input",
  19848. "RCLK": "input",
  19849. "RCLKE": "input",
  19850. "RDATA": "output",
  19851. "RE": "input",
  19852. "WADDR": "input",
  19853. "WCLKE": "input",
  19854. "WCLKN": "input",
  19855. "WDATA": "input",
  19856. "WE": "input"
  19857. },
  19858. "connections": {
  19859. "MASK": [ 486, 487, 426, 427, 486, 487, 496, 497, 486, 487, 426, 427, 486, 487, 498, 499 ],
  19860. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  19861. "RCLK": [ 42 ],
  19862. "RCLKE": [ 400 ],
  19863. "RDATA": [ 345, 500, 385, 501, 359, 502, 145, 503, 353, 504, 384, 505, 293, 506, 379, 507 ],
  19864. "RE": [ "1" ],
  19865. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  19866. "WCLKE": [ 417 ],
  19867. "WCLKN": [ 42 ],
  19868. "WDATA": [ 442, 442, 508, 508, 444, 444, 445, 445, 446, 446, 509, 509, 448, 448, 449, 449 ],
  19869. "WE": [ "1" ]
  19870. }
  19871. },
  19872. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O": {
  19873. "hide_name": 0,
  19874. "type": "SB_LUT4",
  19875. "parameters": {
  19876. "LUT_INIT": "1111110101110101"
  19877. },
  19878. "attributes": {
  19879. "module_not_derived": "00000000000000000000000000000001",
  19880. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19881. },
  19882. "port_directions": {
  19883. "I0": "input",
  19884. "I1": "input",
  19885. "I2": "input",
  19886. "I3": "input",
  19887. "O": "output"
  19888. },
  19889. "connections": {
  19890. "I0": [ 379 ],
  19891. "I1": [ 125 ],
  19892. "I2": [ 510 ],
  19893. "I3": [ 511 ],
  19894. "O": [ 512 ]
  19895. }
  19896. },
  19897. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_1": {
  19898. "hide_name": 0,
  19899. "type": "SB_LUT4",
  19900. "parameters": {
  19901. "LUT_INIT": "1111111111010101"
  19902. },
  19903. "attributes": {
  19904. "module_not_derived": "00000000000000000000000000000001",
  19905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19906. },
  19907. "port_directions": {
  19908. "I0": "input",
  19909. "I1": "input",
  19910. "I2": "input",
  19911. "I3": "input",
  19912. "O": "output"
  19913. },
  19914. "connections": {
  19915. "I0": [ 379 ],
  19916. "I1": [ 121 ],
  19917. "I2": [ 513 ],
  19918. "I3": [ 514 ],
  19919. "O": [ 515 ]
  19920. }
  19921. },
  19922. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O": {
  19923. "hide_name": 0,
  19924. "type": "SB_LUT4",
  19925. "parameters": {
  19926. "LUT_INIT": "0000000000111100"
  19927. },
  19928. "attributes": {
  19929. "module_not_derived": "00000000000000000000000000000001",
  19930. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  19931. },
  19932. "port_directions": {
  19933. "I0": "input",
  19934. "I1": "input",
  19935. "I2": "input",
  19936. "I3": "input",
  19937. "O": "output"
  19938. },
  19939. "connections": {
  19940. "I0": [ "0" ],
  19941. "I1": [ 385 ],
  19942. "I2": [ 383 ],
  19943. "I3": [ 516 ],
  19944. "O": [ 513 ]
  19945. }
  19946. },
  19947. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  19948. "hide_name": 0,
  19949. "type": "SB_LUT4",
  19950. "parameters": {
  19951. "LUT_INIT": "0100000011001000"
  19952. },
  19953. "attributes": {
  19954. "module_not_derived": "00000000000000000000000000000001",
  19955. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19956. },
  19957. "port_directions": {
  19958. "I0": "input",
  19959. "I1": "input",
  19960. "I2": "input",
  19961. "I3": "input",
  19962. "O": "output"
  19963. },
  19964. "connections": {
  19965. "I0": [ 385 ],
  19966. "I1": [ 137 ],
  19967. "I2": [ 517 ],
  19968. "I3": [ 518 ],
  19969. "O": [ 514 ]
  19970. }
  19971. },
  19972. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O": {
  19973. "hide_name": 0,
  19974. "type": "SB_LUT4",
  19975. "parameters": {
  19976. "LUT_INIT": "0000101000001110"
  19977. },
  19978. "attributes": {
  19979. "module_not_derived": "00000000000000000000000000000001",
  19980. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  19981. },
  19982. "port_directions": {
  19983. "I0": "input",
  19984. "I1": "input",
  19985. "I2": "input",
  19986. "I3": "input",
  19987. "O": "output"
  19988. },
  19989. "connections": {
  19990. "I0": [ 384 ],
  19991. "I1": [ 385 ],
  19992. "I2": [ 204 ],
  19993. "I3": [ 461 ],
  19994. "O": [ 511 ]
  19995. }
  19996. },
  19997. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O_1": {
  19998. "hide_name": 0,
  19999. "type": "SB_LUT4",
  20000. "parameters": {
  20001. "LUT_INIT": "0000000001101010"
  20002. },
  20003. "attributes": {
  20004. "module_not_derived": "00000000000000000000000000000001",
  20005. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20006. },
  20007. "port_directions": {
  20008. "I0": "input",
  20009. "I1": "input",
  20010. "I2": "input",
  20011. "I3": "input",
  20012. "O": "output"
  20013. },
  20014. "connections": {
  20015. "I0": [ 384 ],
  20016. "I1": [ 385 ],
  20017. "I2": [ 383 ],
  20018. "I3": [ 516 ],
  20019. "O": [ 510 ]
  20020. }
  20021. },
  20022. "cache_I.genblk1[1].tag_ram_I.w_msk_SB_LUT4_O": {
  20023. "hide_name": 0,
  20024. "type": "SB_LUT4",
  20025. "parameters": {
  20026. "LUT_INIT": "1111001111111111"
  20027. },
  20028. "attributes": {
  20029. "module_not_derived": "00000000000000000000000000000001",
  20030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  20031. },
  20032. "port_directions": {
  20033. "I0": "input",
  20034. "I1": "input",
  20035. "I2": "input",
  20036. "I3": "input",
  20037. "O": "output"
  20038. },
  20039. "connections": {
  20040. "I0": [ "0" ],
  20041. "I1": [ 123 ],
  20042. "I2": [ 124 ],
  20043. "I3": [ 516 ],
  20044. "O": [ 519 ]
  20045. }
  20046. },
  20047. "cache_I.genblk1[1].tag_ram_I.w_msk_SB_LUT4_O_1": {
  20048. "hide_name": 0,
  20049. "type": "SB_LUT4",
  20050. "parameters": {
  20051. "LUT_INIT": "1111111100001111"
  20052. },
  20053. "attributes": {
  20054. "module_not_derived": "00000000000000000000000000000001",
  20055. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20056. },
  20057. "port_directions": {
  20058. "I0": "input",
  20059. "I1": "input",
  20060. "I2": "input",
  20061. "I3": "input",
  20062. "O": "output"
  20063. },
  20064. "connections": {
  20065. "I0": [ "0" ],
  20066. "I1": [ "0" ],
  20067. "I2": [ 516 ],
  20068. "I3": [ 125 ],
  20069. "O": [ 520 ]
  20070. }
  20071. },
  20072. "cache_I.genblk1[1].tag_ram_I.w_msk_SB_LUT4_O_2": {
  20073. "hide_name": 0,
  20074. "type": "SB_LUT4",
  20075. "parameters": {
  20076. "LUT_INIT": "0011010100111111"
  20077. },
  20078. "attributes": {
  20079. "module_not_derived": "00000000000000000000000000000001",
  20080. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20081. },
  20082. "port_directions": {
  20083. "I0": "input",
  20084. "I1": "input",
  20085. "I2": "input",
  20086. "I3": "input",
  20087. "O": "output"
  20088. },
  20089. "connections": {
  20090. "I0": [ 204 ],
  20091. "I1": [ 516 ],
  20092. "I2": [ 121 ],
  20093. "I3": [ 231 ],
  20094. "O": [ 521 ]
  20095. }
  20096. },
  20097. "cache_I.genblk1[1].tag_ram_I.w_msk_SB_LUT4_O_I3_SB_LUT4_O": {
  20098. "hide_name": 0,
  20099. "type": "SB_LUT4",
  20100. "parameters": {
  20101. "LUT_INIT": "0000111100000000"
  20102. },
  20103. "attributes": {
  20104. "module_not_derived": "00000000000000000000000000000001",
  20105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20106. },
  20107. "port_directions": {
  20108. "I0": "input",
  20109. "I1": "input",
  20110. "I2": "input",
  20111. "I3": "input",
  20112. "O": "output"
  20113. },
  20114. "connections": {
  20115. "I0": [ "0" ],
  20116. "I1": [ "0" ],
  20117. "I2": [ 209 ],
  20118. "I3": [ 201 ],
  20119. "O": [ 516 ]
  20120. }
  20121. },
  20122. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_DFF_Q": {
  20123. "hide_name": 0,
  20124. "type": "SB_DFF",
  20125. "parameters": {
  20126. },
  20127. "attributes": {
  20128. "module_not_derived": "00000000000000000000000000000001",
  20129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20130. },
  20131. "port_directions": {
  20132. "C": "input",
  20133. "D": "input",
  20134. "Q": "output"
  20135. },
  20136. "connections": {
  20137. "C": [ 42 ],
  20138. "D": [ 520 ],
  20139. "Q": [ 522 ]
  20140. }
  20141. },
  20142. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_DFF_Q_1": {
  20143. "hide_name": 0,
  20144. "type": "SB_DFF",
  20145. "parameters": {
  20146. },
  20147. "attributes": {
  20148. "module_not_derived": "00000000000000000000000000000001",
  20149. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20150. },
  20151. "port_directions": {
  20152. "C": "input",
  20153. "D": "input",
  20154. "Q": "output"
  20155. },
  20156. "connections": {
  20157. "C": [ 42 ],
  20158. "D": [ 521 ],
  20159. "Q": [ 523 ]
  20160. }
  20161. },
  20162. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_DFF_Q_2": {
  20163. "hide_name": 0,
  20164. "type": "SB_DFF",
  20165. "parameters": {
  20166. },
  20167. "attributes": {
  20168. "module_not_derived": "00000000000000000000000000000001",
  20169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20170. },
  20171. "port_directions": {
  20172. "C": "input",
  20173. "D": "input",
  20174. "Q": "output"
  20175. },
  20176. "connections": {
  20177. "C": [ 42 ],
  20178. "D": [ 519 ],
  20179. "Q": [ 524 ]
  20180. }
  20181. },
  20182. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3": {
  20183. "hide_name": 0,
  20184. "type": "SB_LUT4",
  20185. "parameters": {
  20186. "LUT_INIT": "1111111100001111"
  20187. },
  20188. "attributes": {
  20189. "module_not_derived": "00000000000000000000000000000001",
  20190. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20191. },
  20192. "port_directions": {
  20193. "I0": "input",
  20194. "I1": "input",
  20195. "I2": "input",
  20196. "I3": "input",
  20197. "O": "output"
  20198. },
  20199. "connections": {
  20200. "I0": [ "0" ],
  20201. "I1": [ "0" ],
  20202. "I2": [ 426 ],
  20203. "I3": [ 524 ],
  20204. "O": [ 487 ]
  20205. }
  20206. },
  20207. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3_1": {
  20208. "hide_name": 0,
  20209. "type": "SB_LUT4",
  20210. "parameters": {
  20211. "LUT_INIT": "1111111111110000"
  20212. },
  20213. "attributes": {
  20214. "module_not_derived": "00000000000000000000000000000001",
  20215. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20216. },
  20217. "port_directions": {
  20218. "I0": "input",
  20219. "I1": "input",
  20220. "I2": "input",
  20221. "I3": "input",
  20222. "O": "output"
  20223. },
  20224. "connections": {
  20225. "I0": [ "0" ],
  20226. "I1": [ "0" ],
  20227. "I2": [ 426 ],
  20228. "I3": [ 524 ],
  20229. "O": [ 486 ]
  20230. }
  20231. },
  20232. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3_2": {
  20233. "hide_name": 0,
  20234. "type": "SB_LUT4",
  20235. "parameters": {
  20236. "LUT_INIT": "1111111100001111"
  20237. },
  20238. "attributes": {
  20239. "module_not_derived": "00000000000000000000000000000001",
  20240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20241. },
  20242. "port_directions": {
  20243. "I0": "input",
  20244. "I1": "input",
  20245. "I2": "input",
  20246. "I3": "input",
  20247. "O": "output"
  20248. },
  20249. "connections": {
  20250. "I0": [ "0" ],
  20251. "I1": [ "0" ],
  20252. "I2": [ 426 ],
  20253. "I3": [ 522 ],
  20254. "O": [ 499 ]
  20255. }
  20256. },
  20257. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3_3": {
  20258. "hide_name": 0,
  20259. "type": "SB_LUT4",
  20260. "parameters": {
  20261. "LUT_INIT": "1111111111110000"
  20262. },
  20263. "attributes": {
  20264. "module_not_derived": "00000000000000000000000000000001",
  20265. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20266. },
  20267. "port_directions": {
  20268. "I0": "input",
  20269. "I1": "input",
  20270. "I2": "input",
  20271. "I3": "input",
  20272. "O": "output"
  20273. },
  20274. "connections": {
  20275. "I0": [ "0" ],
  20276. "I1": [ "0" ],
  20277. "I2": [ 426 ],
  20278. "I3": [ 522 ],
  20279. "O": [ 498 ]
  20280. }
  20281. },
  20282. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3_4": {
  20283. "hide_name": 0,
  20284. "type": "SB_LUT4",
  20285. "parameters": {
  20286. "LUT_INIT": "1111111100001111"
  20287. },
  20288. "attributes": {
  20289. "module_not_derived": "00000000000000000000000000000001",
  20290. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20291. },
  20292. "port_directions": {
  20293. "I0": "input",
  20294. "I1": "input",
  20295. "I2": "input",
  20296. "I3": "input",
  20297. "O": "output"
  20298. },
  20299. "connections": {
  20300. "I0": [ "0" ],
  20301. "I1": [ "0" ],
  20302. "I2": [ 426 ],
  20303. "I3": [ 523 ],
  20304. "O": [ 497 ]
  20305. }
  20306. },
  20307. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3_5": {
  20308. "hide_name": 0,
  20309. "type": "SB_LUT4",
  20310. "parameters": {
  20311. "LUT_INIT": "1111111111110000"
  20312. },
  20313. "attributes": {
  20314. "module_not_derived": "00000000000000000000000000000001",
  20315. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20316. },
  20317. "port_directions": {
  20318. "I0": "input",
  20319. "I1": "input",
  20320. "I2": "input",
  20321. "I3": "input",
  20322. "O": "output"
  20323. },
  20324. "connections": {
  20325. "I0": [ "0" ],
  20326. "I1": [ "0" ],
  20327. "I2": [ 426 ],
  20328. "I3": [ 523 ],
  20329. "O": [ 496 ]
  20330. }
  20331. },
  20332. "cache_I.genblk1[1].tag_ram_I.w_val_r_SB_DFF_Q": {
  20333. "hide_name": 0,
  20334. "type": "SB_DFF",
  20335. "parameters": {
  20336. },
  20337. "attributes": {
  20338. "module_not_derived": "00000000000000000000000000000001",
  20339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20340. },
  20341. "port_directions": {
  20342. "C": "input",
  20343. "D": "input",
  20344. "Q": "output"
  20345. },
  20346. "connections": {
  20347. "C": [ 42 ],
  20348. "D": [ 512 ],
  20349. "Q": [ 509 ]
  20350. }
  20351. },
  20352. "cache_I.genblk1[1].tag_ram_I.w_val_r_SB_DFF_Q_1": {
  20353. "hide_name": 0,
  20354. "type": "SB_DFF",
  20355. "parameters": {
  20356. },
  20357. "attributes": {
  20358. "module_not_derived": "00000000000000000000000000000001",
  20359. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20360. },
  20361. "port_directions": {
  20362. "C": "input",
  20363. "D": "input",
  20364. "Q": "output"
  20365. },
  20366. "connections": {
  20367. "C": [ 42 ],
  20368. "D": [ 515 ],
  20369. "Q": [ 508 ]
  20370. }
  20371. },
  20372. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  20373. "hide_name": 0,
  20374. "type": "SB_RAM40_4KNW",
  20375. "parameters": {
  20376. "READ_MODE": "00000000000000000000000000000001",
  20377. "WRITE_MODE": "00000000000000000000000000000000"
  20378. },
  20379. "attributes": {
  20380. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I genblk2.genblk1.genblk1.ebr_I",
  20381. "module_not_derived": "00000000000000000000000000000001",
  20382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  20383. },
  20384. "port_directions": {
  20385. "MASK": "input",
  20386. "RADDR": "input",
  20387. "RCLK": "input",
  20388. "RCLKE": "input",
  20389. "RDATA": "output",
  20390. "RE": "input",
  20391. "WADDR": "input",
  20392. "WCLKE": "input",
  20393. "WCLKN": "input",
  20394. "WDATA": "input",
  20395. "WE": "input"
  20396. },
  20397. "connections": {
  20398. "MASK": [ 525, 526, 525, 526, 525, 526, 525, 526, 525, 526, 525, 526, 525, 526, 525, 526 ],
  20399. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  20400. "RCLK": [ 42 ],
  20401. "RCLKE": [ 400 ],
  20402. "RDATA": [ 299, 527, 316, 528, 305, 529, 332, 530, 388, 531, 325, 532, 311, 533, 337, 534 ],
  20403. "RE": [ "1" ],
  20404. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  20405. "WCLKE": [ 417 ],
  20406. "WCLKN": [ 42 ],
  20407. "WDATA": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  20408. "WE": [ "1" ]
  20409. }
  20410. },
  20411. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  20412. "hide_name": 0,
  20413. "type": "SB_RAM40_4KNW",
  20414. "parameters": {
  20415. "READ_MODE": "00000000000000000000000000000001",
  20416. "WRITE_MODE": "00000000000000000000000000000000"
  20417. },
  20418. "attributes": {
  20419. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I genblk2.genblk1.genblk1.ebr_I",
  20420. "module_not_derived": "00000000000000000000000000000001",
  20421. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  20422. },
  20423. "port_directions": {
  20424. "MASK": "input",
  20425. "RADDR": "input",
  20426. "RCLK": "input",
  20427. "RCLKE": "input",
  20428. "RDATA": "output",
  20429. "RE": "input",
  20430. "WADDR": "input",
  20431. "WCLKE": "input",
  20432. "WCLKN": "input",
  20433. "WDATA": "input",
  20434. "WE": "input"
  20435. },
  20436. "connections": {
  20437. "MASK": [ 525, 526, 426, 427, 525, 526, 535, 536, 525, 526, 426, 427, 525, 526, 537, 538 ],
  20438. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  20439. "RCLK": [ 42 ],
  20440. "RCLKE": [ 400 ],
  20441. "RDATA": [ 344, 539, 391, 540, 358, 541, 146, 542, 354, 543, 390, 544, 294, 545, 374, 546 ],
  20442. "RE": [ "1" ],
  20443. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  20444. "WCLKE": [ 417 ],
  20445. "WCLKN": [ 42 ],
  20446. "WDATA": [ 442, 442, 547, 547, 444, 444, 445, 445, 446, 446, 548, 548, 448, 448, 449, 449 ],
  20447. "WE": [ "1" ]
  20448. }
  20449. },
  20450. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O": {
  20451. "hide_name": 0,
  20452. "type": "SB_LUT4",
  20453. "parameters": {
  20454. "LUT_INIT": "1111110101110101"
  20455. },
  20456. "attributes": {
  20457. "module_not_derived": "00000000000000000000000000000001",
  20458. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20459. },
  20460. "port_directions": {
  20461. "I0": "input",
  20462. "I1": "input",
  20463. "I2": "input",
  20464. "I3": "input",
  20465. "O": "output"
  20466. },
  20467. "connections": {
  20468. "I0": [ 374 ],
  20469. "I1": [ 125 ],
  20470. "I2": [ 549 ],
  20471. "I3": [ 550 ],
  20472. "O": [ 551 ]
  20473. }
  20474. },
  20475. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1": {
  20476. "hide_name": 0,
  20477. "type": "SB_LUT4",
  20478. "parameters": {
  20479. "LUT_INIT": "1111011111010101"
  20480. },
  20481. "attributes": {
  20482. "module_not_derived": "00000000000000000000000000000001",
  20483. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20484. },
  20485. "port_directions": {
  20486. "I0": "input",
  20487. "I1": "input",
  20488. "I2": "input",
  20489. "I3": "input",
  20490. "O": "output"
  20491. },
  20492. "connections": {
  20493. "I0": [ 374 ],
  20494. "I1": [ 121 ],
  20495. "I2": [ 552 ],
  20496. "I3": [ 553 ],
  20497. "O": [ 554 ]
  20498. }
  20499. },
  20500. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O": {
  20501. "hide_name": 0,
  20502. "type": "SB_LUT4",
  20503. "parameters": {
  20504. "LUT_INIT": "0001000000110010"
  20505. },
  20506. "attributes": {
  20507. "module_not_derived": "00000000000000000000000000000001",
  20508. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20509. },
  20510. "port_directions": {
  20511. "I0": "input",
  20512. "I1": "input",
  20513. "I2": "input",
  20514. "I3": "input",
  20515. "O": "output"
  20516. },
  20517. "connections": {
  20518. "I0": [ 391 ],
  20519. "I1": [ 205 ],
  20520. "I2": [ 555 ],
  20521. "I3": [ 556 ],
  20522. "O": [ 553 ]
  20523. }
  20524. },
  20525. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  20526. "hide_name": 0,
  20527. "type": "SB_LUT4",
  20528. "parameters": {
  20529. "LUT_INIT": "0000000000111100"
  20530. },
  20531. "attributes": {
  20532. "module_not_derived": "00000000000000000000000000000001",
  20533. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  20534. },
  20535. "port_directions": {
  20536. "I0": "input",
  20537. "I1": "input",
  20538. "I2": "input",
  20539. "I3": "input",
  20540. "O": "output"
  20541. },
  20542. "connections": {
  20543. "I0": [ "0" ],
  20544. "I1": [ 391 ],
  20545. "I2": [ 383 ],
  20546. "I3": [ 557 ],
  20547. "O": [ 552 ]
  20548. }
  20549. },
  20550. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  20551. "hide_name": 0,
  20552. "type": "SB_LUT4",
  20553. "parameters": {
  20554. "LUT_INIT": "0000001100111111"
  20555. },
  20556. "attributes": {
  20557. "module_not_derived": "00000000000000000000000000000001",
  20558. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  20559. },
  20560. "port_directions": {
  20561. "I0": "input",
  20562. "I1": "input",
  20563. "I2": "input",
  20564. "I3": "input",
  20565. "O": "output"
  20566. },
  20567. "connections": {
  20568. "I0": [ "0" ],
  20569. "I1": [ 390 ],
  20570. "I2": [ 460 ],
  20571. "I3": [ 461 ],
  20572. "O": [ 555 ]
  20573. }
  20574. },
  20575. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  20576. "hide_name": 0,
  20577. "type": "SB_LUT4",
  20578. "parameters": {
  20579. "LUT_INIT": "0000000000001111"
  20580. },
  20581. "attributes": {
  20582. "module_not_derived": "00000000000000000000000000000001",
  20583. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20584. },
  20585. "port_directions": {
  20586. "I0": "input",
  20587. "I1": "input",
  20588. "I2": "input",
  20589. "I3": "input",
  20590. "O": "output"
  20591. },
  20592. "connections": {
  20593. "I0": [ "0" ],
  20594. "I1": [ "0" ],
  20595. "I2": [ 390 ],
  20596. "I3": [ 461 ],
  20597. "O": [ 556 ]
  20598. }
  20599. },
  20600. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2": {
  20601. "hide_name": 0,
  20602. "type": "SB_LUT4",
  20603. "parameters": {
  20604. "LUT_INIT": "0000001100111111"
  20605. },
  20606. "attributes": {
  20607. "module_not_derived": "00000000000000000000000000000001",
  20608. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  20609. },
  20610. "port_directions": {
  20611. "I0": "input",
  20612. "I1": "input",
  20613. "I2": "input",
  20614. "I3": "input",
  20615. "O": "output"
  20616. },
  20617. "connections": {
  20618. "I0": [ "0" ],
  20619. "I1": [ 384 ],
  20620. "I2": [ 460 ],
  20621. "I3": [ 461 ],
  20622. "O": [ 517 ]
  20623. }
  20624. },
  20625. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O": {
  20626. "hide_name": 0,
  20627. "type": "SB_LUT4",
  20628. "parameters": {
  20629. "LUT_INIT": "0000000000001111"
  20630. },
  20631. "attributes": {
  20632. "module_not_derived": "00000000000000000000000000000001",
  20633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20634. },
  20635. "port_directions": {
  20636. "I0": "input",
  20637. "I1": "input",
  20638. "I2": "input",
  20639. "I3": "input",
  20640. "O": "output"
  20641. },
  20642. "connections": {
  20643. "I0": [ "0" ],
  20644. "I1": [ "0" ],
  20645. "I2": [ 384 ],
  20646. "I3": [ 461 ],
  20647. "O": [ 518 ]
  20648. }
  20649. },
  20650. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O_1": {
  20651. "hide_name": 0,
  20652. "type": "SB_LUT4",
  20653. "parameters": {
  20654. "LUT_INIT": "0000000000001111"
  20655. },
  20656. "attributes": {
  20657. "module_not_derived": "00000000000000000000000000000001",
  20658. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20659. },
  20660. "port_directions": {
  20661. "I0": "input",
  20662. "I1": "input",
  20663. "I2": "input",
  20664. "I3": "input",
  20665. "O": "output"
  20666. },
  20667. "connections": {
  20668. "I0": [ "0" ],
  20669. "I1": [ "0" ],
  20670. "I2": [ 204 ],
  20671. "I3": [ 121 ],
  20672. "O": [ 137 ]
  20673. }
  20674. },
  20675. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  20676. "hide_name": 0,
  20677. "type": "SB_LUT4",
  20678. "parameters": {
  20679. "LUT_INIT": "1111000000000000"
  20680. },
  20681. "attributes": {
  20682. "module_not_derived": "00000000000000000000000000000001",
  20683. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20684. },
  20685. "port_directions": {
  20686. "I0": "input",
  20687. "I1": "input",
  20688. "I2": "input",
  20689. "I3": "input",
  20690. "O": "output"
  20691. },
  20692. "connections": {
  20693. "I0": [ "0" ],
  20694. "I1": [ "0" ],
  20695. "I2": [ 558 ],
  20696. "I3": [ 559 ],
  20697. "O": [ 460 ]
  20698. }
  20699. },
  20700. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  20701. "hide_name": 0,
  20702. "type": "SB_LUT4",
  20703. "parameters": {
  20704. "LUT_INIT": "0001010100111111"
  20705. },
  20706. "attributes": {
  20707. "module_not_derived": "00000000000000000000000000000001",
  20708. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20709. },
  20710. "port_directions": {
  20711. "I0": "input",
  20712. "I1": "input",
  20713. "I2": "input",
  20714. "I3": "input",
  20715. "O": "output"
  20716. },
  20717. "connections": {
  20718. "I0": [ 382 ],
  20719. "I1": [ 433 ],
  20720. "I2": [ 457 ],
  20721. "I3": [ 202 ],
  20722. "O": [ 558 ]
  20723. }
  20724. },
  20725. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  20726. "hide_name": 0,
  20727. "type": "SB_LUT4",
  20728. "parameters": {
  20729. "LUT_INIT": "0001010100111111"
  20730. },
  20731. "attributes": {
  20732. "module_not_derived": "00000000000000000000000000000001",
  20733. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20734. },
  20735. "port_directions": {
  20736. "I0": "input",
  20737. "I1": "input",
  20738. "I2": "input",
  20739. "I3": "input",
  20740. "O": "output"
  20741. },
  20742. "connections": {
  20743. "I0": [ 391 ],
  20744. "I1": [ 385 ],
  20745. "I2": [ 204 ],
  20746. "I3": [ 205 ],
  20747. "O": [ 559 ]
  20748. }
  20749. },
  20750. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O": {
  20751. "hide_name": 0,
  20752. "type": "SB_LUT4",
  20753. "parameters": {
  20754. "LUT_INIT": "0000101000001110"
  20755. },
  20756. "attributes": {
  20757. "module_not_derived": "00000000000000000000000000000001",
  20758. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20759. },
  20760. "port_directions": {
  20761. "I0": "input",
  20762. "I1": "input",
  20763. "I2": "input",
  20764. "I3": "input",
  20765. "O": "output"
  20766. },
  20767. "connections": {
  20768. "I0": [ 390 ],
  20769. "I1": [ 391 ],
  20770. "I2": [ 205 ],
  20771. "I3": [ 461 ],
  20772. "O": [ 550 ]
  20773. }
  20774. },
  20775. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O_1": {
  20776. "hide_name": 0,
  20777. "type": "SB_LUT4",
  20778. "parameters": {
  20779. "LUT_INIT": "0000000001101010"
  20780. },
  20781. "attributes": {
  20782. "module_not_derived": "00000000000000000000000000000001",
  20783. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20784. },
  20785. "port_directions": {
  20786. "I0": "input",
  20787. "I1": "input",
  20788. "I2": "input",
  20789. "I3": "input",
  20790. "O": "output"
  20791. },
  20792. "connections": {
  20793. "I0": [ 390 ],
  20794. "I1": [ 391 ],
  20795. "I2": [ 383 ],
  20796. "I3": [ 557 ],
  20797. "O": [ 549 ]
  20798. }
  20799. },
  20800. "cache_I.genblk1[2].tag_ram_I.w_msk_SB_LUT4_O": {
  20801. "hide_name": 0,
  20802. "type": "SB_LUT4",
  20803. "parameters": {
  20804. "LUT_INIT": "1111001111111111"
  20805. },
  20806. "attributes": {
  20807. "module_not_derived": "00000000000000000000000000000001",
  20808. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  20809. },
  20810. "port_directions": {
  20811. "I0": "input",
  20812. "I1": "input",
  20813. "I2": "input",
  20814. "I3": "input",
  20815. "O": "output"
  20816. },
  20817. "connections": {
  20818. "I0": [ "0" ],
  20819. "I1": [ 123 ],
  20820. "I2": [ 124 ],
  20821. "I3": [ 557 ],
  20822. "O": [ 560 ]
  20823. }
  20824. },
  20825. "cache_I.genblk1[2].tag_ram_I.w_msk_SB_LUT4_O_1": {
  20826. "hide_name": 0,
  20827. "type": "SB_LUT4",
  20828. "parameters": {
  20829. "LUT_INIT": "1111111100001111"
  20830. },
  20831. "attributes": {
  20832. "module_not_derived": "00000000000000000000000000000001",
  20833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20834. },
  20835. "port_directions": {
  20836. "I0": "input",
  20837. "I1": "input",
  20838. "I2": "input",
  20839. "I3": "input",
  20840. "O": "output"
  20841. },
  20842. "connections": {
  20843. "I0": [ "0" ],
  20844. "I1": [ "0" ],
  20845. "I2": [ 557 ],
  20846. "I3": [ 125 ],
  20847. "O": [ 561 ]
  20848. }
  20849. },
  20850. "cache_I.genblk1[2].tag_ram_I.w_msk_SB_LUT4_O_2": {
  20851. "hide_name": 0,
  20852. "type": "SB_LUT4",
  20853. "parameters": {
  20854. "LUT_INIT": "0011010100111111"
  20855. },
  20856. "attributes": {
  20857. "module_not_derived": "00000000000000000000000000000001",
  20858. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  20859. },
  20860. "port_directions": {
  20861. "I0": "input",
  20862. "I1": "input",
  20863. "I2": "input",
  20864. "I3": "input",
  20865. "O": "output"
  20866. },
  20867. "connections": {
  20868. "I0": [ 205 ],
  20869. "I1": [ 557 ],
  20870. "I2": [ 121 ],
  20871. "I3": [ 231 ],
  20872. "O": [ 562 ]
  20873. }
  20874. },
  20875. "cache_I.genblk1[2].tag_ram_I.w_msk_SB_LUT4_O_I3_SB_LUT4_O": {
  20876. "hide_name": 0,
  20877. "type": "SB_LUT4",
  20878. "parameters": {
  20879. "LUT_INIT": "0000000011110000"
  20880. },
  20881. "attributes": {
  20882. "module_not_derived": "00000000000000000000000000000001",
  20883. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20884. },
  20885. "port_directions": {
  20886. "I0": "input",
  20887. "I1": "input",
  20888. "I2": "input",
  20889. "I3": "input",
  20890. "O": "output"
  20891. },
  20892. "connections": {
  20893. "I0": [ "0" ],
  20894. "I1": [ "0" ],
  20895. "I2": [ 209 ],
  20896. "I3": [ 201 ],
  20897. "O": [ 557 ]
  20898. }
  20899. },
  20900. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_DFF_Q": {
  20901. "hide_name": 0,
  20902. "type": "SB_DFF",
  20903. "parameters": {
  20904. },
  20905. "attributes": {
  20906. "module_not_derived": "00000000000000000000000000000001",
  20907. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20908. },
  20909. "port_directions": {
  20910. "C": "input",
  20911. "D": "input",
  20912. "Q": "output"
  20913. },
  20914. "connections": {
  20915. "C": [ 42 ],
  20916. "D": [ 561 ],
  20917. "Q": [ 563 ]
  20918. }
  20919. },
  20920. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_DFF_Q_1": {
  20921. "hide_name": 0,
  20922. "type": "SB_DFF",
  20923. "parameters": {
  20924. },
  20925. "attributes": {
  20926. "module_not_derived": "00000000000000000000000000000001",
  20927. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20928. },
  20929. "port_directions": {
  20930. "C": "input",
  20931. "D": "input",
  20932. "Q": "output"
  20933. },
  20934. "connections": {
  20935. "C": [ 42 ],
  20936. "D": [ 562 ],
  20937. "Q": [ 564 ]
  20938. }
  20939. },
  20940. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_DFF_Q_2": {
  20941. "hide_name": 0,
  20942. "type": "SB_DFF",
  20943. "parameters": {
  20944. },
  20945. "attributes": {
  20946. "module_not_derived": "00000000000000000000000000000001",
  20947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  20948. },
  20949. "port_directions": {
  20950. "C": "input",
  20951. "D": "input",
  20952. "Q": "output"
  20953. },
  20954. "connections": {
  20955. "C": [ 42 ],
  20956. "D": [ 560 ],
  20957. "Q": [ 565 ]
  20958. }
  20959. },
  20960. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3": {
  20961. "hide_name": 0,
  20962. "type": "SB_LUT4",
  20963. "parameters": {
  20964. "LUT_INIT": "1111111100001111"
  20965. },
  20966. "attributes": {
  20967. "module_not_derived": "00000000000000000000000000000001",
  20968. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20969. },
  20970. "port_directions": {
  20971. "I0": "input",
  20972. "I1": "input",
  20973. "I2": "input",
  20974. "I3": "input",
  20975. "O": "output"
  20976. },
  20977. "connections": {
  20978. "I0": [ "0" ],
  20979. "I1": [ "0" ],
  20980. "I2": [ 426 ],
  20981. "I3": [ 565 ],
  20982. "O": [ 526 ]
  20983. }
  20984. },
  20985. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3_1": {
  20986. "hide_name": 0,
  20987. "type": "SB_LUT4",
  20988. "parameters": {
  20989. "LUT_INIT": "1111111111110000"
  20990. },
  20991. "attributes": {
  20992. "module_not_derived": "00000000000000000000000000000001",
  20993. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  20994. },
  20995. "port_directions": {
  20996. "I0": "input",
  20997. "I1": "input",
  20998. "I2": "input",
  20999. "I3": "input",
  21000. "O": "output"
  21001. },
  21002. "connections": {
  21003. "I0": [ "0" ],
  21004. "I1": [ "0" ],
  21005. "I2": [ 426 ],
  21006. "I3": [ 565 ],
  21007. "O": [ 525 ]
  21008. }
  21009. },
  21010. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3_2": {
  21011. "hide_name": 0,
  21012. "type": "SB_LUT4",
  21013. "parameters": {
  21014. "LUT_INIT": "1111111100001111"
  21015. },
  21016. "attributes": {
  21017. "module_not_derived": "00000000000000000000000000000001",
  21018. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21019. },
  21020. "port_directions": {
  21021. "I0": "input",
  21022. "I1": "input",
  21023. "I2": "input",
  21024. "I3": "input",
  21025. "O": "output"
  21026. },
  21027. "connections": {
  21028. "I0": [ "0" ],
  21029. "I1": [ "0" ],
  21030. "I2": [ 426 ],
  21031. "I3": [ 563 ],
  21032. "O": [ 538 ]
  21033. }
  21034. },
  21035. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3_3": {
  21036. "hide_name": 0,
  21037. "type": "SB_LUT4",
  21038. "parameters": {
  21039. "LUT_INIT": "1111111111110000"
  21040. },
  21041. "attributes": {
  21042. "module_not_derived": "00000000000000000000000000000001",
  21043. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21044. },
  21045. "port_directions": {
  21046. "I0": "input",
  21047. "I1": "input",
  21048. "I2": "input",
  21049. "I3": "input",
  21050. "O": "output"
  21051. },
  21052. "connections": {
  21053. "I0": [ "0" ],
  21054. "I1": [ "0" ],
  21055. "I2": [ 426 ],
  21056. "I3": [ 563 ],
  21057. "O": [ 537 ]
  21058. }
  21059. },
  21060. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3_4": {
  21061. "hide_name": 0,
  21062. "type": "SB_LUT4",
  21063. "parameters": {
  21064. "LUT_INIT": "1111111100001111"
  21065. },
  21066. "attributes": {
  21067. "module_not_derived": "00000000000000000000000000000001",
  21068. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21069. },
  21070. "port_directions": {
  21071. "I0": "input",
  21072. "I1": "input",
  21073. "I2": "input",
  21074. "I3": "input",
  21075. "O": "output"
  21076. },
  21077. "connections": {
  21078. "I0": [ "0" ],
  21079. "I1": [ "0" ],
  21080. "I2": [ 426 ],
  21081. "I3": [ 564 ],
  21082. "O": [ 536 ]
  21083. }
  21084. },
  21085. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3_5": {
  21086. "hide_name": 0,
  21087. "type": "SB_LUT4",
  21088. "parameters": {
  21089. "LUT_INIT": "1111111111110000"
  21090. },
  21091. "attributes": {
  21092. "module_not_derived": "00000000000000000000000000000001",
  21093. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21094. },
  21095. "port_directions": {
  21096. "I0": "input",
  21097. "I1": "input",
  21098. "I2": "input",
  21099. "I3": "input",
  21100. "O": "output"
  21101. },
  21102. "connections": {
  21103. "I0": [ "0" ],
  21104. "I1": [ "0" ],
  21105. "I2": [ 426 ],
  21106. "I3": [ 564 ],
  21107. "O": [ 535 ]
  21108. }
  21109. },
  21110. "cache_I.genblk1[2].tag_ram_I.w_val_r_SB_DFF_Q": {
  21111. "hide_name": 0,
  21112. "type": "SB_DFF",
  21113. "parameters": {
  21114. },
  21115. "attributes": {
  21116. "module_not_derived": "00000000000000000000000000000001",
  21117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21118. },
  21119. "port_directions": {
  21120. "C": "input",
  21121. "D": "input",
  21122. "Q": "output"
  21123. },
  21124. "connections": {
  21125. "C": [ 42 ],
  21126. "D": [ 551 ],
  21127. "Q": [ 548 ]
  21128. }
  21129. },
  21130. "cache_I.genblk1[2].tag_ram_I.w_val_r_SB_DFF_Q_1": {
  21131. "hide_name": 0,
  21132. "type": "SB_DFF",
  21133. "parameters": {
  21134. },
  21135. "attributes": {
  21136. "module_not_derived": "00000000000000000000000000000001",
  21137. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21138. },
  21139. "port_directions": {
  21140. "C": "input",
  21141. "D": "input",
  21142. "Q": "output"
  21143. },
  21144. "connections": {
  21145. "C": [ 42 ],
  21146. "D": [ 554 ],
  21147. "Q": [ 547 ]
  21148. }
  21149. },
  21150. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  21151. "hide_name": 0,
  21152. "type": "SB_RAM40_4KNW",
  21153. "parameters": {
  21154. "READ_MODE": "00000000000000000000000000000001",
  21155. "WRITE_MODE": "00000000000000000000000000000000"
  21156. },
  21157. "attributes": {
  21158. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I genblk2.genblk1.genblk1.ebr_I",
  21159. "module_not_derived": "00000000000000000000000000000001",
  21160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  21161. },
  21162. "port_directions": {
  21163. "MASK": "input",
  21164. "RADDR": "input",
  21165. "RCLK": "input",
  21166. "RCLKE": "input",
  21167. "RDATA": "output",
  21168. "RE": "input",
  21169. "WADDR": "input",
  21170. "WCLKE": "input",
  21171. "WCLKN": "input",
  21172. "WDATA": "input",
  21173. "WE": "input"
  21174. },
  21175. "connections": {
  21176. "MASK": [ 566, 567, 566, 567, 566, 567, 566, 567, 566, 567, 566, 567, 566, 567, 566, 567 ],
  21177. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  21178. "RCLK": [ 42 ],
  21179. "RCLKE": [ 400 ],
  21180. "RDATA": [ 301, 568, 318, 569, 303, 570, 331, 571, 389, 572, 323, 573, 312, 574, 340, 575 ],
  21181. "RE": [ "1" ],
  21182. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  21183. "WCLKE": [ 417 ],
  21184. "WCLKN": [ 42 ],
  21185. "WDATA": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  21186. "WE": [ "1" ]
  21187. }
  21188. },
  21189. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I": {
  21190. "hide_name": 0,
  21191. "type": "SB_RAM40_4KNW",
  21192. "parameters": {
  21193. "READ_MODE": "00000000000000000000000000000001",
  21194. "WRITE_MODE": "00000000000000000000000000000000"
  21195. },
  21196. "attributes": {
  21197. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I genblk2.genblk1.genblk1.ebr_I",
  21198. "module_not_derived": "00000000000000000000000000000001",
  21199. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5"
  21200. },
  21201. "port_directions": {
  21202. "MASK": "input",
  21203. "RADDR": "input",
  21204. "RCLK": "input",
  21205. "RCLKE": "input",
  21206. "RDATA": "output",
  21207. "RE": "input",
  21208. "WADDR": "input",
  21209. "WCLKE": "input",
  21210. "WCLKN": "input",
  21211. "WDATA": "input",
  21212. "WE": "input"
  21213. },
  21214. "connections": {
  21215. "MASK": [ 566, 567, 426, 427, 566, 567, 576, 577, 566, 567, 426, 427, 566, 567, 578, 579 ],
  21216. "RADDR": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  21217. "RCLK": [ 42 ],
  21218. "RCLKE": [ 400 ],
  21219. "RDATA": [ 347, 580, 382, 581, 361, 582, 143, 583, 351, 584, 380, 585, 292, 586, 381, 587 ],
  21220. "RE": [ "1" ],
  21221. "WADDR": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  21222. "WCLKE": [ 417 ],
  21223. "WCLKN": [ 42 ],
  21224. "WDATA": [ 442, 442, 588, 588, 444, 444, 445, 445, 446, 446, 589, 589, 448, 448, 449, 449 ],
  21225. "WE": [ "1" ]
  21226. }
  21227. },
  21228. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O": {
  21229. "hide_name": 0,
  21230. "type": "SB_LUT4",
  21231. "parameters": {
  21232. "LUT_INIT": "1111110101110101"
  21233. },
  21234. "attributes": {
  21235. "module_not_derived": "00000000000000000000000000000001",
  21236. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  21237. },
  21238. "port_directions": {
  21239. "I0": "input",
  21240. "I1": "input",
  21241. "I2": "input",
  21242. "I3": "input",
  21243. "O": "output"
  21244. },
  21245. "connections": {
  21246. "I0": [ 381 ],
  21247. "I1": [ 125 ],
  21248. "I2": [ 590 ],
  21249. "I3": [ 591 ],
  21250. "O": [ 592 ]
  21251. }
  21252. },
  21253. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1": {
  21254. "hide_name": 0,
  21255. "type": "SB_LUT4",
  21256. "parameters": {
  21257. "LUT_INIT": "1111011111010101"
  21258. },
  21259. "attributes": {
  21260. "module_not_derived": "00000000000000000000000000000001",
  21261. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  21262. },
  21263. "port_directions": {
  21264. "I0": "input",
  21265. "I1": "input",
  21266. "I2": "input",
  21267. "I3": "input",
  21268. "O": "output"
  21269. },
  21270. "connections": {
  21271. "I0": [ 381 ],
  21272. "I1": [ 121 ],
  21273. "I2": [ 593 ],
  21274. "I3": [ 594 ],
  21275. "O": [ 595 ]
  21276. }
  21277. },
  21278. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O": {
  21279. "hide_name": 0,
  21280. "type": "SB_LUT4",
  21281. "parameters": {
  21282. "LUT_INIT": "0000000000111100"
  21283. },
  21284. "attributes": {
  21285. "module_not_derived": "00000000000000000000000000000001",
  21286. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  21287. },
  21288. "port_directions": {
  21289. "I0": "input",
  21290. "I1": "input",
  21291. "I2": "input",
  21292. "I3": "input",
  21293. "O": "output"
  21294. },
  21295. "connections": {
  21296. "I0": [ "0" ],
  21297. "I1": [ 382 ],
  21298. "I2": [ 383 ],
  21299. "I3": [ 596 ],
  21300. "O": [ 593 ]
  21301. }
  21302. },
  21303. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  21304. "hide_name": 0,
  21305. "type": "SB_LUT4",
  21306. "parameters": {
  21307. "LUT_INIT": "0001000000110010"
  21308. },
  21309. "attributes": {
  21310. "module_not_derived": "00000000000000000000000000000001",
  21311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  21312. },
  21313. "port_directions": {
  21314. "I0": "input",
  21315. "I1": "input",
  21316. "I2": "input",
  21317. "I3": "input",
  21318. "O": "output"
  21319. },
  21320. "connections": {
  21321. "I0": [ 382 ],
  21322. "I1": [ 202 ],
  21323. "I2": [ 597 ],
  21324. "I3": [ 598 ],
  21325. "O": [ 594 ]
  21326. }
  21327. },
  21328. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  21329. "hide_name": 0,
  21330. "type": "SB_LUT4",
  21331. "parameters": {
  21332. "LUT_INIT": "0000001100111111"
  21333. },
  21334. "attributes": {
  21335. "module_not_derived": "00000000000000000000000000000001",
  21336. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  21337. },
  21338. "port_directions": {
  21339. "I0": "input",
  21340. "I1": "input",
  21341. "I2": "input",
  21342. "I3": "input",
  21343. "O": "output"
  21344. },
  21345. "connections": {
  21346. "I0": [ "0" ],
  21347. "I1": [ 380 ],
  21348. "I2": [ 460 ],
  21349. "I3": [ 461 ],
  21350. "O": [ 597 ]
  21351. }
  21352. },
  21353. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  21354. "hide_name": 0,
  21355. "type": "SB_LUT4",
  21356. "parameters": {
  21357. "LUT_INIT": "0000000000001111"
  21358. },
  21359. "attributes": {
  21360. "module_not_derived": "00000000000000000000000000000001",
  21361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21362. },
  21363. "port_directions": {
  21364. "I0": "input",
  21365. "I1": "input",
  21366. "I2": "input",
  21367. "I3": "input",
  21368. "O": "output"
  21369. },
  21370. "connections": {
  21371. "I0": [ "0" ],
  21372. "I1": [ "0" ],
  21373. "I2": [ 380 ],
  21374. "I3": [ 461 ],
  21375. "O": [ 598 ]
  21376. }
  21377. },
  21378. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O": {
  21379. "hide_name": 0,
  21380. "type": "SB_LUT4",
  21381. "parameters": {
  21382. "LUT_INIT": "0000101000001110"
  21383. },
  21384. "attributes": {
  21385. "module_not_derived": "00000000000000000000000000000001",
  21386. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  21387. },
  21388. "port_directions": {
  21389. "I0": "input",
  21390. "I1": "input",
  21391. "I2": "input",
  21392. "I3": "input",
  21393. "O": "output"
  21394. },
  21395. "connections": {
  21396. "I0": [ 380 ],
  21397. "I1": [ 382 ],
  21398. "I2": [ 202 ],
  21399. "I3": [ 461 ],
  21400. "O": [ 591 ]
  21401. }
  21402. },
  21403. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O_1": {
  21404. "hide_name": 0,
  21405. "type": "SB_LUT4",
  21406. "parameters": {
  21407. "LUT_INIT": "0000000001101010"
  21408. },
  21409. "attributes": {
  21410. "module_not_derived": "00000000000000000000000000000001",
  21411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  21412. },
  21413. "port_directions": {
  21414. "I0": "input",
  21415. "I1": "input",
  21416. "I2": "input",
  21417. "I3": "input",
  21418. "O": "output"
  21419. },
  21420. "connections": {
  21421. "I0": [ 380 ],
  21422. "I1": [ 382 ],
  21423. "I2": [ 383 ],
  21424. "I3": [ 596 ],
  21425. "O": [ 590 ]
  21426. }
  21427. },
  21428. "cache_I.genblk1[3].tag_ram_I.w_msk_SB_LUT4_O": {
  21429. "hide_name": 0,
  21430. "type": "SB_LUT4",
  21431. "parameters": {
  21432. "LUT_INIT": "1111001111111111"
  21433. },
  21434. "attributes": {
  21435. "module_not_derived": "00000000000000000000000000000001",
  21436. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  21437. },
  21438. "port_directions": {
  21439. "I0": "input",
  21440. "I1": "input",
  21441. "I2": "input",
  21442. "I3": "input",
  21443. "O": "output"
  21444. },
  21445. "connections": {
  21446. "I0": [ "0" ],
  21447. "I1": [ 123 ],
  21448. "I2": [ 124 ],
  21449. "I3": [ 596 ],
  21450. "O": [ 599 ]
  21451. }
  21452. },
  21453. "cache_I.genblk1[3].tag_ram_I.w_msk_SB_LUT4_O_1": {
  21454. "hide_name": 0,
  21455. "type": "SB_LUT4",
  21456. "parameters": {
  21457. "LUT_INIT": "1111111100001111"
  21458. },
  21459. "attributes": {
  21460. "module_not_derived": "00000000000000000000000000000001",
  21461. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21462. },
  21463. "port_directions": {
  21464. "I0": "input",
  21465. "I1": "input",
  21466. "I2": "input",
  21467. "I3": "input",
  21468. "O": "output"
  21469. },
  21470. "connections": {
  21471. "I0": [ "0" ],
  21472. "I1": [ "0" ],
  21473. "I2": [ 596 ],
  21474. "I3": [ 125 ],
  21475. "O": [ 600 ]
  21476. }
  21477. },
  21478. "cache_I.genblk1[3].tag_ram_I.w_msk_SB_LUT4_O_2": {
  21479. "hide_name": 0,
  21480. "type": "SB_LUT4",
  21481. "parameters": {
  21482. "LUT_INIT": "0011010100111111"
  21483. },
  21484. "attributes": {
  21485. "module_not_derived": "00000000000000000000000000000001",
  21486. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  21487. },
  21488. "port_directions": {
  21489. "I0": "input",
  21490. "I1": "input",
  21491. "I2": "input",
  21492. "I3": "input",
  21493. "O": "output"
  21494. },
  21495. "connections": {
  21496. "I0": [ 202 ],
  21497. "I1": [ 596 ],
  21498. "I2": [ 121 ],
  21499. "I3": [ 231 ],
  21500. "O": [ 601 ]
  21501. }
  21502. },
  21503. "cache_I.genblk1[3].tag_ram_I.w_msk_SB_LUT4_O_I3_SB_LUT4_O": {
  21504. "hide_name": 0,
  21505. "type": "SB_LUT4",
  21506. "parameters": {
  21507. "LUT_INIT": "1111000000000000"
  21508. },
  21509. "attributes": {
  21510. "module_not_derived": "00000000000000000000000000000001",
  21511. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21512. },
  21513. "port_directions": {
  21514. "I0": "input",
  21515. "I1": "input",
  21516. "I2": "input",
  21517. "I3": "input",
  21518. "O": "output"
  21519. },
  21520. "connections": {
  21521. "I0": [ "0" ],
  21522. "I1": [ "0" ],
  21523. "I2": [ 209 ],
  21524. "I3": [ 201 ],
  21525. "O": [ 596 ]
  21526. }
  21527. },
  21528. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_DFF_Q": {
  21529. "hide_name": 0,
  21530. "type": "SB_DFF",
  21531. "parameters": {
  21532. },
  21533. "attributes": {
  21534. "module_not_derived": "00000000000000000000000000000001",
  21535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21536. },
  21537. "port_directions": {
  21538. "C": "input",
  21539. "D": "input",
  21540. "Q": "output"
  21541. },
  21542. "connections": {
  21543. "C": [ 42 ],
  21544. "D": [ 600 ],
  21545. "Q": [ 602 ]
  21546. }
  21547. },
  21548. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_DFF_Q_1": {
  21549. "hide_name": 0,
  21550. "type": "SB_DFF",
  21551. "parameters": {
  21552. },
  21553. "attributes": {
  21554. "module_not_derived": "00000000000000000000000000000001",
  21555. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21556. },
  21557. "port_directions": {
  21558. "C": "input",
  21559. "D": "input",
  21560. "Q": "output"
  21561. },
  21562. "connections": {
  21563. "C": [ 42 ],
  21564. "D": [ 601 ],
  21565. "Q": [ 603 ]
  21566. }
  21567. },
  21568. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_DFF_Q_2": {
  21569. "hide_name": 0,
  21570. "type": "SB_DFF",
  21571. "parameters": {
  21572. },
  21573. "attributes": {
  21574. "module_not_derived": "00000000000000000000000000000001",
  21575. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21576. },
  21577. "port_directions": {
  21578. "C": "input",
  21579. "D": "input",
  21580. "Q": "output"
  21581. },
  21582. "connections": {
  21583. "C": [ 42 ],
  21584. "D": [ 599 ],
  21585. "Q": [ 604 ]
  21586. }
  21587. },
  21588. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3": {
  21589. "hide_name": 0,
  21590. "type": "SB_LUT4",
  21591. "parameters": {
  21592. "LUT_INIT": "1111111100001111"
  21593. },
  21594. "attributes": {
  21595. "module_not_derived": "00000000000000000000000000000001",
  21596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21597. },
  21598. "port_directions": {
  21599. "I0": "input",
  21600. "I1": "input",
  21601. "I2": "input",
  21602. "I3": "input",
  21603. "O": "output"
  21604. },
  21605. "connections": {
  21606. "I0": [ "0" ],
  21607. "I1": [ "0" ],
  21608. "I2": [ 426 ],
  21609. "I3": [ 604 ],
  21610. "O": [ 567 ]
  21611. }
  21612. },
  21613. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_1": {
  21614. "hide_name": 0,
  21615. "type": "SB_LUT4",
  21616. "parameters": {
  21617. "LUT_INIT": "1111111111110000"
  21618. },
  21619. "attributes": {
  21620. "module_not_derived": "00000000000000000000000000000001",
  21621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21622. },
  21623. "port_directions": {
  21624. "I0": "input",
  21625. "I1": "input",
  21626. "I2": "input",
  21627. "I3": "input",
  21628. "O": "output"
  21629. },
  21630. "connections": {
  21631. "I0": [ "0" ],
  21632. "I1": [ "0" ],
  21633. "I2": [ 426 ],
  21634. "I3": [ 604 ],
  21635. "O": [ 566 ]
  21636. }
  21637. },
  21638. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_2": {
  21639. "hide_name": 0,
  21640. "type": "SB_LUT4",
  21641. "parameters": {
  21642. "LUT_INIT": "1111111100001111"
  21643. },
  21644. "attributes": {
  21645. "module_not_derived": "00000000000000000000000000000001",
  21646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21647. },
  21648. "port_directions": {
  21649. "I0": "input",
  21650. "I1": "input",
  21651. "I2": "input",
  21652. "I3": "input",
  21653. "O": "output"
  21654. },
  21655. "connections": {
  21656. "I0": [ "0" ],
  21657. "I1": [ "0" ],
  21658. "I2": [ 426 ],
  21659. "I3": [ 602 ],
  21660. "O": [ 579 ]
  21661. }
  21662. },
  21663. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_3": {
  21664. "hide_name": 0,
  21665. "type": "SB_LUT4",
  21666. "parameters": {
  21667. "LUT_INIT": "1111111111110000"
  21668. },
  21669. "attributes": {
  21670. "module_not_derived": "00000000000000000000000000000001",
  21671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21672. },
  21673. "port_directions": {
  21674. "I0": "input",
  21675. "I1": "input",
  21676. "I2": "input",
  21677. "I3": "input",
  21678. "O": "output"
  21679. },
  21680. "connections": {
  21681. "I0": [ "0" ],
  21682. "I1": [ "0" ],
  21683. "I2": [ 426 ],
  21684. "I3": [ 602 ],
  21685. "O": [ 578 ]
  21686. }
  21687. },
  21688. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_4": {
  21689. "hide_name": 0,
  21690. "type": "SB_LUT4",
  21691. "parameters": {
  21692. "LUT_INIT": "1111111100001111"
  21693. },
  21694. "attributes": {
  21695. "module_not_derived": "00000000000000000000000000000001",
  21696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21697. },
  21698. "port_directions": {
  21699. "I0": "input",
  21700. "I1": "input",
  21701. "I2": "input",
  21702. "I3": "input",
  21703. "O": "output"
  21704. },
  21705. "connections": {
  21706. "I0": [ "0" ],
  21707. "I1": [ "0" ],
  21708. "I2": [ 426 ],
  21709. "I3": [ 603 ],
  21710. "O": [ 577 ]
  21711. }
  21712. },
  21713. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_5": {
  21714. "hide_name": 0,
  21715. "type": "SB_LUT4",
  21716. "parameters": {
  21717. "LUT_INIT": "1111111111110000"
  21718. },
  21719. "attributes": {
  21720. "module_not_derived": "00000000000000000000000000000001",
  21721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21722. },
  21723. "port_directions": {
  21724. "I0": "input",
  21725. "I1": "input",
  21726. "I2": "input",
  21727. "I3": "input",
  21728. "O": "output"
  21729. },
  21730. "connections": {
  21731. "I0": [ "0" ],
  21732. "I1": [ "0" ],
  21733. "I2": [ 426 ],
  21734. "I3": [ 603 ],
  21735. "O": [ 576 ]
  21736. }
  21737. },
  21738. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_5_O_SB_LUT4_O": {
  21739. "hide_name": 0,
  21740. "type": "SB_LUT4",
  21741. "parameters": {
  21742. "LUT_INIT": "0000000011111111"
  21743. },
  21744. "attributes": {
  21745. "module_not_derived": "00000000000000000000000000000001",
  21746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  21747. },
  21748. "port_directions": {
  21749. "I0": "input",
  21750. "I1": "input",
  21751. "I2": "input",
  21752. "I3": "input",
  21753. "O": "output"
  21754. },
  21755. "connections": {
  21756. "I0": [ "0" ],
  21757. "I1": [ "0" ],
  21758. "I2": [ "0" ],
  21759. "I3": [ 426 ],
  21760. "O": [ 427 ]
  21761. }
  21762. },
  21763. "cache_I.genblk1[3].tag_ram_I.w_val_r_SB_DFF_Q": {
  21764. "hide_name": 0,
  21765. "type": "SB_DFF",
  21766. "parameters": {
  21767. },
  21768. "attributes": {
  21769. "module_not_derived": "00000000000000000000000000000001",
  21770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21771. },
  21772. "port_directions": {
  21773. "C": "input",
  21774. "D": "input",
  21775. "Q": "output"
  21776. },
  21777. "connections": {
  21778. "C": [ 42 ],
  21779. "D": [ 592 ],
  21780. "Q": [ 589 ]
  21781. }
  21782. },
  21783. "cache_I.genblk1[3].tag_ram_I.w_val_r_SB_DFF_Q_1": {
  21784. "hide_name": 0,
  21785. "type": "SB_DFF",
  21786. "parameters": {
  21787. },
  21788. "attributes": {
  21789. "module_not_derived": "00000000000000000000000000000001",
  21790. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:114.2-120.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  21791. },
  21792. "port_directions": {
  21793. "C": "input",
  21794. "D": "input",
  21795. "Q": "output"
  21796. },
  21797. "connections": {
  21798. "C": [ 42 ],
  21799. "D": [ 595 ],
  21800. "Q": [ 588 ]
  21801. }
  21802. },
  21803. "cache_I.genblk2[0].tag_match_I.agg_out_SB_LUT4_I2": {
  21804. "hide_name": 0,
  21805. "type": "SB_LUT4",
  21806. "parameters": {
  21807. "LUT_INIT": "1111000000000000"
  21808. },
  21809. "attributes": {
  21810. "module_not_derived": "00000000000000000000000000000001",
  21811. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  21812. },
  21813. "port_directions": {
  21814. "I0": "input",
  21815. "I1": "input",
  21816. "I2": "input",
  21817. "I3": "input",
  21818. "O": "output"
  21819. },
  21820. "connections": {
  21821. "I0": [ "0" ],
  21822. "I1": [ "0" ],
  21823. "I2": [ 605 ],
  21824. "I3": [ 606 ],
  21825. "O": [ 457 ]
  21826. }
  21827. },
  21828. "cache_I.genblk2[0].tag_match_I.agg_out_SB_LUT4_I2_O_SB_LUT4_I2": {
  21829. "hide_name": 0,
  21830. "type": "SB_LUT4",
  21831. "parameters": {
  21832. "LUT_INIT": "0011111100000000"
  21833. },
  21834. "attributes": {
  21835. "module_not_derived": "00000000000000000000000000000001",
  21836. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  21837. },
  21838. "port_directions": {
  21839. "I0": "input",
  21840. "I1": "input",
  21841. "I2": "input",
  21842. "I3": "input",
  21843. "O": "output"
  21844. },
  21845. "connections": {
  21846. "I0": [ "0" ],
  21847. "I1": [ 438 ],
  21848. "I2": [ 457 ],
  21849. "I3": [ 462 ],
  21850. "O": [ 461 ]
  21851. }
  21852. },
  21853. "cache_I.genblk2[0].tag_match_I.agg_out_SB_LUT4_I2_O_SB_LUT4_O": {
  21854. "hide_name": 0,
  21855. "type": "SB_LUT4",
  21856. "parameters": {
  21857. "LUT_INIT": "0011111100000000"
  21858. },
  21859. "attributes": {
  21860. "module_not_derived": "00000000000000000000000000000001",
  21861. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  21862. },
  21863. "port_directions": {
  21864. "I0": "input",
  21865. "I1": "input",
  21866. "I2": "input",
  21867. "I3": "input",
  21868. "O": "output"
  21869. },
  21870. "connections": {
  21871. "I0": [ "0" ],
  21872. "I1": [ 380 ],
  21873. "I2": [ 202 ],
  21874. "I3": [ 607 ],
  21875. "O": [ 462 ]
  21876. }
  21877. },
  21878. "cache_I.genblk2[0].tag_match_I.genblk1[0].lut_cmp_I": {
  21879. "hide_name": 0,
  21880. "type": "SB_LUT4",
  21881. "parameters": {
  21882. "LUT_INIT": "1001000000001001"
  21883. },
  21884. "attributes": {
  21885. "hdlname": "cache_I genblk2[0].tag_match_I genblk1[0].lut_cmp_I",
  21886. "module_not_derived": "00000000000000000000000000000001",
  21887. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  21888. },
  21889. "port_directions": {
  21890. "I0": "input",
  21891. "I1": "input",
  21892. "I2": "input",
  21893. "I3": "input",
  21894. "O": "output"
  21895. },
  21896. "connections": {
  21897. "I0": [ 479 ],
  21898. "I1": [ 300 ],
  21899. "I2": [ 478 ],
  21900. "I3": [ 387 ],
  21901. "O": [ 608 ]
  21902. }
  21903. },
  21904. "cache_I.genblk2[0].tag_match_I.genblk1[1].lut_cmp_I": {
  21905. "hide_name": 0,
  21906. "type": "SB_LUT4",
  21907. "parameters": {
  21908. "LUT_INIT": "1001000000001001"
  21909. },
  21910. "attributes": {
  21911. "hdlname": "cache_I genblk2[0].tag_match_I genblk1[1].lut_cmp_I",
  21912. "module_not_derived": "00000000000000000000000000000001",
  21913. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  21914. },
  21915. "port_directions": {
  21916. "I0": "input",
  21917. "I1": "input",
  21918. "I2": "input",
  21919. "I3": "input",
  21920. "O": "output"
  21921. },
  21922. "connections": {
  21923. "I0": [ 477 ],
  21924. "I1": [ 302 ],
  21925. "I2": [ 476 ],
  21926. "I3": [ 310 ],
  21927. "O": [ 609 ]
  21928. }
  21929. },
  21930. "cache_I.genblk2[0].tag_match_I.genblk1[2].lut_cmp_I": {
  21931. "hide_name": 0,
  21932. "type": "SB_LUT4",
  21933. "parameters": {
  21934. "LUT_INIT": "1001000000001001"
  21935. },
  21936. "attributes": {
  21937. "hdlname": "cache_I genblk2[0].tag_match_I genblk1[2].lut_cmp_I",
  21938. "module_not_derived": "00000000000000000000000000000001",
  21939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  21940. },
  21941. "port_directions": {
  21942. "I0": "input",
  21943. "I1": "input",
  21944. "I2": "input",
  21945. "I3": "input",
  21946. "O": "output"
  21947. },
  21948. "connections": {
  21949. "I0": [ 475 ],
  21950. "I1": [ 319 ],
  21951. "I2": [ 474 ],
  21952. "I3": [ 326 ],
  21953. "O": [ 610 ]
  21954. }
  21955. },
  21956. "cache_I.genblk2[0].tag_match_I.genblk1[3].lut_cmp_I": {
  21957. "hide_name": 0,
  21958. "type": "SB_LUT4",
  21959. "parameters": {
  21960. "LUT_INIT": "1001000000001001"
  21961. },
  21962. "attributes": {
  21963. "hdlname": "cache_I genblk2[0].tag_match_I genblk1[3].lut_cmp_I",
  21964. "module_not_derived": "00000000000000000000000000000001",
  21965. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  21966. },
  21967. "port_directions": {
  21968. "I0": "input",
  21969. "I1": "input",
  21970. "I2": "input",
  21971. "I3": "input",
  21972. "O": "output"
  21973. },
  21974. "connections": {
  21975. "I0": [ 485 ],
  21976. "I1": [ 330 ],
  21977. "I2": [ 484 ],
  21978. "I3": [ 339 ],
  21979. "O": [ 611 ]
  21980. }
  21981. },
  21982. "cache_I.genblk2[0].tag_match_I.genblk1[4].lut_cmp_I": {
  21983. "hide_name": 0,
  21984. "type": "SB_LUT4",
  21985. "parameters": {
  21986. "LUT_INIT": "1001000000001001"
  21987. },
  21988. "attributes": {
  21989. "hdlname": "cache_I genblk2[0].tag_match_I genblk1[4].lut_cmp_I",
  21990. "module_not_derived": "00000000000000000000000000000001",
  21991. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  21992. },
  21993. "port_directions": {
  21994. "I0": "input",
  21995. "I1": "input",
  21996. "I2": "input",
  21997. "I3": "input",
  21998. "O": "output"
  21999. },
  22000. "connections": {
  22001. "I0": [ 483 ],
  22002. "I1": [ 346 ],
  22003. "I2": [ 482 ],
  22004. "I3": [ 352 ],
  22005. "O": [ 612 ]
  22006. }
  22007. },
  22008. "cache_I.genblk2[0].tag_match_I.genblk1[5].lut_cmp_I": {
  22009. "hide_name": 0,
  22010. "type": "SB_LUT4",
  22011. "parameters": {
  22012. "LUT_INIT": "1001000000001001"
  22013. },
  22014. "attributes": {
  22015. "hdlname": "cache_I genblk2[0].tag_match_I genblk1[5].lut_cmp_I",
  22016. "module_not_derived": "00000000000000000000000000000001",
  22017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22018. },
  22019. "port_directions": {
  22020. "I0": "input",
  22021. "I1": "input",
  22022. "I2": "input",
  22023. "I3": "input",
  22024. "O": "output"
  22025. },
  22026. "connections": {
  22027. "I0": [ 481 ],
  22028. "I1": [ 360 ],
  22029. "I2": [ 480 ],
  22030. "I3": [ 291 ],
  22031. "O": [ 613 ]
  22032. }
  22033. },
  22034. "cache_I.genblk2[0].tag_match_I.genblk2[0].lut_cmp_I": {
  22035. "hide_name": 0,
  22036. "type": "SB_LUT4",
  22037. "parameters": {
  22038. "LUT_INIT": "1000000000000000"
  22039. },
  22040. "attributes": {
  22041. "hdlname": "cache_I genblk2[0].tag_match_I genblk2[0].lut_cmp_I",
  22042. "module_not_derived": "00000000000000000000000000000001",
  22043. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22044. },
  22045. "port_directions": {
  22046. "I0": "input",
  22047. "I1": "input",
  22048. "I2": "input",
  22049. "I3": "input",
  22050. "O": "output"
  22051. },
  22052. "connections": {
  22053. "I0": [ 611 ],
  22054. "I1": [ 610 ],
  22055. "I2": [ 609 ],
  22056. "I3": [ 608 ],
  22057. "O": [ 606 ]
  22058. }
  22059. },
  22060. "cache_I.genblk2[0].tag_match_I.genblk2[1].lut_cmp_I": {
  22061. "hide_name": 0,
  22062. "type": "SB_LUT4",
  22063. "parameters": {
  22064. "LUT_INIT": "1000000000000000"
  22065. },
  22066. "attributes": {
  22067. "hdlname": "cache_I genblk2[0].tag_match_I genblk2[1].lut_cmp_I",
  22068. "module_not_derived": "00000000000000000000000000000001",
  22069. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22070. },
  22071. "port_directions": {
  22072. "I0": "input",
  22073. "I1": "input",
  22074. "I2": "input",
  22075. "I3": "input",
  22076. "O": "output"
  22077. },
  22078. "connections": {
  22079. "I0": [ "1" ],
  22080. "I1": [ 378 ],
  22081. "I2": [ 613 ],
  22082. "I3": [ 612 ],
  22083. "O": [ 605 ]
  22084. }
  22085. },
  22086. "cache_I.genblk2[1].tag_match_I.agg_out_SB_LUT4_I2": {
  22087. "hide_name": 0,
  22088. "type": "SB_LUT4",
  22089. "parameters": {
  22090. "LUT_INIT": "1111000000000000"
  22091. },
  22092. "attributes": {
  22093. "module_not_derived": "00000000000000000000000000000001",
  22094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  22095. },
  22096. "port_directions": {
  22097. "I0": "input",
  22098. "I1": "input",
  22099. "I2": "input",
  22100. "I3": "input",
  22101. "O": "output"
  22102. },
  22103. "connections": {
  22104. "I0": [ "0" ],
  22105. "I1": [ "0" ],
  22106. "I2": [ 614 ],
  22107. "I3": [ 615 ],
  22108. "O": [ 204 ]
  22109. }
  22110. },
  22111. "cache_I.genblk2[1].tag_match_I.genblk1[0].lut_cmp_I": {
  22112. "hide_name": 0,
  22113. "type": "SB_LUT4",
  22114. "parameters": {
  22115. "LUT_INIT": "1001000000001001"
  22116. },
  22117. "attributes": {
  22118. "hdlname": "cache_I genblk2[1].tag_match_I genblk1[0].lut_cmp_I",
  22119. "module_not_derived": "00000000000000000000000000000001",
  22120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22121. },
  22122. "port_directions": {
  22123. "I0": "input",
  22124. "I1": "input",
  22125. "I2": "input",
  22126. "I3": "input",
  22127. "O": "output"
  22128. },
  22129. "connections": {
  22130. "I0": [ 479 ],
  22131. "I1": [ 298 ],
  22132. "I2": [ 478 ],
  22133. "I3": [ 281 ],
  22134. "O": [ 616 ]
  22135. }
  22136. },
  22137. "cache_I.genblk2[1].tag_match_I.genblk1[1].lut_cmp_I": {
  22138. "hide_name": 0,
  22139. "type": "SB_LUT4",
  22140. "parameters": {
  22141. "LUT_INIT": "1001000000001001"
  22142. },
  22143. "attributes": {
  22144. "hdlname": "cache_I genblk2[1].tag_match_I genblk1[1].lut_cmp_I",
  22145. "module_not_derived": "00000000000000000000000000000001",
  22146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22147. },
  22148. "port_directions": {
  22149. "I0": "input",
  22150. "I1": "input",
  22151. "I2": "input",
  22152. "I3": "input",
  22153. "O": "output"
  22154. },
  22155. "connections": {
  22156. "I0": [ 477 ],
  22157. "I1": [ 304 ],
  22158. "I2": [ 476 ],
  22159. "I3": [ 306 ],
  22160. "O": [ 617 ]
  22161. }
  22162. },
  22163. "cache_I.genblk2[1].tag_match_I.genblk1[2].lut_cmp_I": {
  22164. "hide_name": 0,
  22165. "type": "SB_LUT4",
  22166. "parameters": {
  22167. "LUT_INIT": "1001000000001001"
  22168. },
  22169. "attributes": {
  22170. "hdlname": "cache_I genblk2[1].tag_match_I genblk1[2].lut_cmp_I",
  22171. "module_not_derived": "00000000000000000000000000000001",
  22172. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22173. },
  22174. "port_directions": {
  22175. "I0": "input",
  22176. "I1": "input",
  22177. "I2": "input",
  22178. "I3": "input",
  22179. "O": "output"
  22180. },
  22181. "connections": {
  22182. "I0": [ 475 ],
  22183. "I1": [ 317 ],
  22184. "I2": [ 474 ],
  22185. "I3": [ 324 ],
  22186. "O": [ 618 ]
  22187. }
  22188. },
  22189. "cache_I.genblk2[1].tag_match_I.genblk1[3].lut_cmp_I": {
  22190. "hide_name": 0,
  22191. "type": "SB_LUT4",
  22192. "parameters": {
  22193. "LUT_INIT": "1001000000001001"
  22194. },
  22195. "attributes": {
  22196. "hdlname": "cache_I genblk2[1].tag_match_I genblk1[3].lut_cmp_I",
  22197. "module_not_derived": "00000000000000000000000000000001",
  22198. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22199. },
  22200. "port_directions": {
  22201. "I0": "input",
  22202. "I1": "input",
  22203. "I2": "input",
  22204. "I3": "input",
  22205. "O": "output"
  22206. },
  22207. "connections": {
  22208. "I0": [ 485 ],
  22209. "I1": [ 333 ],
  22210. "I2": [ 484 ],
  22211. "I3": [ 338 ],
  22212. "O": [ 619 ]
  22213. }
  22214. },
  22215. "cache_I.genblk2[1].tag_match_I.genblk1[4].lut_cmp_I": {
  22216. "hide_name": 0,
  22217. "type": "SB_LUT4",
  22218. "parameters": {
  22219. "LUT_INIT": "1001000000001001"
  22220. },
  22221. "attributes": {
  22222. "hdlname": "cache_I genblk2[1].tag_match_I genblk1[4].lut_cmp_I",
  22223. "module_not_derived": "00000000000000000000000000000001",
  22224. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22225. },
  22226. "port_directions": {
  22227. "I0": "input",
  22228. "I1": "input",
  22229. "I2": "input",
  22230. "I3": "input",
  22231. "O": "output"
  22232. },
  22233. "connections": {
  22234. "I0": [ 483 ],
  22235. "I1": [ 345 ],
  22236. "I2": [ 482 ],
  22237. "I3": [ 353 ],
  22238. "O": [ 620 ]
  22239. }
  22240. },
  22241. "cache_I.genblk2[1].tag_match_I.genblk1[5].lut_cmp_I": {
  22242. "hide_name": 0,
  22243. "type": "SB_LUT4",
  22244. "parameters": {
  22245. "LUT_INIT": "1001000000001001"
  22246. },
  22247. "attributes": {
  22248. "hdlname": "cache_I genblk2[1].tag_match_I genblk1[5].lut_cmp_I",
  22249. "module_not_derived": "00000000000000000000000000000001",
  22250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22251. },
  22252. "port_directions": {
  22253. "I0": "input",
  22254. "I1": "input",
  22255. "I2": "input",
  22256. "I3": "input",
  22257. "O": "output"
  22258. },
  22259. "connections": {
  22260. "I0": [ 481 ],
  22261. "I1": [ 359 ],
  22262. "I2": [ 480 ],
  22263. "I3": [ 293 ],
  22264. "O": [ 621 ]
  22265. }
  22266. },
  22267. "cache_I.genblk2[1].tag_match_I.genblk2[0].lut_cmp_I": {
  22268. "hide_name": 0,
  22269. "type": "SB_LUT4",
  22270. "parameters": {
  22271. "LUT_INIT": "1000000000000000"
  22272. },
  22273. "attributes": {
  22274. "hdlname": "cache_I genblk2[1].tag_match_I genblk2[0].lut_cmp_I",
  22275. "module_not_derived": "00000000000000000000000000000001",
  22276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22277. },
  22278. "port_directions": {
  22279. "I0": "input",
  22280. "I1": "input",
  22281. "I2": "input",
  22282. "I3": "input",
  22283. "O": "output"
  22284. },
  22285. "connections": {
  22286. "I0": [ 619 ],
  22287. "I1": [ 618 ],
  22288. "I2": [ 617 ],
  22289. "I3": [ 616 ],
  22290. "O": [ 615 ]
  22291. }
  22292. },
  22293. "cache_I.genblk2[1].tag_match_I.genblk2[1].lut_cmp_I": {
  22294. "hide_name": 0,
  22295. "type": "SB_LUT4",
  22296. "parameters": {
  22297. "LUT_INIT": "1000000000000000"
  22298. },
  22299. "attributes": {
  22300. "hdlname": "cache_I genblk2[1].tag_match_I genblk2[1].lut_cmp_I",
  22301. "module_not_derived": "00000000000000000000000000000001",
  22302. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22303. },
  22304. "port_directions": {
  22305. "I0": "input",
  22306. "I1": "input",
  22307. "I2": "input",
  22308. "I3": "input",
  22309. "O": "output"
  22310. },
  22311. "connections": {
  22312. "I0": [ "1" ],
  22313. "I1": [ 379 ],
  22314. "I2": [ 621 ],
  22315. "I3": [ 620 ],
  22316. "O": [ 614 ]
  22317. }
  22318. },
  22319. "cache_I.genblk2[2].tag_match_I.agg_out_SB_LUT4_I2": {
  22320. "hide_name": 0,
  22321. "type": "SB_LUT4",
  22322. "parameters": {
  22323. "LUT_INIT": "1111000000000000"
  22324. },
  22325. "attributes": {
  22326. "module_not_derived": "00000000000000000000000000000001",
  22327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  22328. },
  22329. "port_directions": {
  22330. "I0": "input",
  22331. "I1": "input",
  22332. "I2": "input",
  22333. "I3": "input",
  22334. "O": "output"
  22335. },
  22336. "connections": {
  22337. "I0": [ "0" ],
  22338. "I1": [ "0" ],
  22339. "I2": [ 622 ],
  22340. "I3": [ 623 ],
  22341. "O": [ 205 ]
  22342. }
  22343. },
  22344. "cache_I.genblk2[2].tag_match_I.genblk1[0].lut_cmp_I": {
  22345. "hide_name": 0,
  22346. "type": "SB_LUT4",
  22347. "parameters": {
  22348. "LUT_INIT": "1001000000001001"
  22349. },
  22350. "attributes": {
  22351. "hdlname": "cache_I genblk2[2].tag_match_I genblk1[0].lut_cmp_I",
  22352. "module_not_derived": "00000000000000000000000000000001",
  22353. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22354. },
  22355. "port_directions": {
  22356. "I0": "input",
  22357. "I1": "input",
  22358. "I2": "input",
  22359. "I3": "input",
  22360. "O": "output"
  22361. },
  22362. "connections": {
  22363. "I0": [ 479 ],
  22364. "I1": [ 299 ],
  22365. "I2": [ 478 ],
  22366. "I3": [ 388 ],
  22367. "O": [ 624 ]
  22368. }
  22369. },
  22370. "cache_I.genblk2[2].tag_match_I.genblk1[1].lut_cmp_I": {
  22371. "hide_name": 0,
  22372. "type": "SB_LUT4",
  22373. "parameters": {
  22374. "LUT_INIT": "1001000000001001"
  22375. },
  22376. "attributes": {
  22377. "hdlname": "cache_I genblk2[2].tag_match_I genblk1[1].lut_cmp_I",
  22378. "module_not_derived": "00000000000000000000000000000001",
  22379. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22380. },
  22381. "port_directions": {
  22382. "I0": "input",
  22383. "I1": "input",
  22384. "I2": "input",
  22385. "I3": "input",
  22386. "O": "output"
  22387. },
  22388. "connections": {
  22389. "I0": [ 477 ],
  22390. "I1": [ 305 ],
  22391. "I2": [ 476 ],
  22392. "I3": [ 311 ],
  22393. "O": [ 625 ]
  22394. }
  22395. },
  22396. "cache_I.genblk2[2].tag_match_I.genblk1[2].lut_cmp_I": {
  22397. "hide_name": 0,
  22398. "type": "SB_LUT4",
  22399. "parameters": {
  22400. "LUT_INIT": "1001000000001001"
  22401. },
  22402. "attributes": {
  22403. "hdlname": "cache_I genblk2[2].tag_match_I genblk1[2].lut_cmp_I",
  22404. "module_not_derived": "00000000000000000000000000000001",
  22405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22406. },
  22407. "port_directions": {
  22408. "I0": "input",
  22409. "I1": "input",
  22410. "I2": "input",
  22411. "I3": "input",
  22412. "O": "output"
  22413. },
  22414. "connections": {
  22415. "I0": [ 475 ],
  22416. "I1": [ 316 ],
  22417. "I2": [ 474 ],
  22418. "I3": [ 325 ],
  22419. "O": [ 626 ]
  22420. }
  22421. },
  22422. "cache_I.genblk2[2].tag_match_I.genblk1[3].lut_cmp_I": {
  22423. "hide_name": 0,
  22424. "type": "SB_LUT4",
  22425. "parameters": {
  22426. "LUT_INIT": "1001000000001001"
  22427. },
  22428. "attributes": {
  22429. "hdlname": "cache_I genblk2[2].tag_match_I genblk1[3].lut_cmp_I",
  22430. "module_not_derived": "00000000000000000000000000000001",
  22431. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22432. },
  22433. "port_directions": {
  22434. "I0": "input",
  22435. "I1": "input",
  22436. "I2": "input",
  22437. "I3": "input",
  22438. "O": "output"
  22439. },
  22440. "connections": {
  22441. "I0": [ 485 ],
  22442. "I1": [ 332 ],
  22443. "I2": [ 484 ],
  22444. "I3": [ 337 ],
  22445. "O": [ 627 ]
  22446. }
  22447. },
  22448. "cache_I.genblk2[2].tag_match_I.genblk1[4].lut_cmp_I": {
  22449. "hide_name": 0,
  22450. "type": "SB_LUT4",
  22451. "parameters": {
  22452. "LUT_INIT": "1001000000001001"
  22453. },
  22454. "attributes": {
  22455. "hdlname": "cache_I genblk2[2].tag_match_I genblk1[4].lut_cmp_I",
  22456. "module_not_derived": "00000000000000000000000000000001",
  22457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22458. },
  22459. "port_directions": {
  22460. "I0": "input",
  22461. "I1": "input",
  22462. "I2": "input",
  22463. "I3": "input",
  22464. "O": "output"
  22465. },
  22466. "connections": {
  22467. "I0": [ 483 ],
  22468. "I1": [ 344 ],
  22469. "I2": [ 482 ],
  22470. "I3": [ 354 ],
  22471. "O": [ 628 ]
  22472. }
  22473. },
  22474. "cache_I.genblk2[2].tag_match_I.genblk1[5].lut_cmp_I": {
  22475. "hide_name": 0,
  22476. "type": "SB_LUT4",
  22477. "parameters": {
  22478. "LUT_INIT": "1001000000001001"
  22479. },
  22480. "attributes": {
  22481. "hdlname": "cache_I genblk2[2].tag_match_I genblk1[5].lut_cmp_I",
  22482. "module_not_derived": "00000000000000000000000000000001",
  22483. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22484. },
  22485. "port_directions": {
  22486. "I0": "input",
  22487. "I1": "input",
  22488. "I2": "input",
  22489. "I3": "input",
  22490. "O": "output"
  22491. },
  22492. "connections": {
  22493. "I0": [ 481 ],
  22494. "I1": [ 358 ],
  22495. "I2": [ 480 ],
  22496. "I3": [ 294 ],
  22497. "O": [ 629 ]
  22498. }
  22499. },
  22500. "cache_I.genblk2[2].tag_match_I.genblk2[0].lut_cmp_I": {
  22501. "hide_name": 0,
  22502. "type": "SB_LUT4",
  22503. "parameters": {
  22504. "LUT_INIT": "1000000000000000"
  22505. },
  22506. "attributes": {
  22507. "hdlname": "cache_I genblk2[2].tag_match_I genblk2[0].lut_cmp_I",
  22508. "module_not_derived": "00000000000000000000000000000001",
  22509. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22510. },
  22511. "port_directions": {
  22512. "I0": "input",
  22513. "I1": "input",
  22514. "I2": "input",
  22515. "I3": "input",
  22516. "O": "output"
  22517. },
  22518. "connections": {
  22519. "I0": [ 627 ],
  22520. "I1": [ 626 ],
  22521. "I2": [ 625 ],
  22522. "I3": [ 624 ],
  22523. "O": [ 623 ]
  22524. }
  22525. },
  22526. "cache_I.genblk2[2].tag_match_I.genblk2[1].lut_cmp_I": {
  22527. "hide_name": 0,
  22528. "type": "SB_LUT4",
  22529. "parameters": {
  22530. "LUT_INIT": "1000000000000000"
  22531. },
  22532. "attributes": {
  22533. "hdlname": "cache_I genblk2[2].tag_match_I genblk2[1].lut_cmp_I",
  22534. "module_not_derived": "00000000000000000000000000000001",
  22535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22536. },
  22537. "port_directions": {
  22538. "I0": "input",
  22539. "I1": "input",
  22540. "I2": "input",
  22541. "I3": "input",
  22542. "O": "output"
  22543. },
  22544. "connections": {
  22545. "I0": [ "1" ],
  22546. "I1": [ 374 ],
  22547. "I2": [ 629 ],
  22548. "I3": [ 628 ],
  22549. "O": [ 622 ]
  22550. }
  22551. },
  22552. "cache_I.genblk2[3].tag_match_I.agg_out_SB_LUT4_I2": {
  22553. "hide_name": 0,
  22554. "type": "SB_LUT4",
  22555. "parameters": {
  22556. "LUT_INIT": "1111000000000000"
  22557. },
  22558. "attributes": {
  22559. "module_not_derived": "00000000000000000000000000000001",
  22560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  22561. },
  22562. "port_directions": {
  22563. "I0": "input",
  22564. "I1": "input",
  22565. "I2": "input",
  22566. "I3": "input",
  22567. "O": "output"
  22568. },
  22569. "connections": {
  22570. "I0": [ "0" ],
  22571. "I1": [ "0" ],
  22572. "I2": [ 630 ],
  22573. "I3": [ 631 ],
  22574. "O": [ 202 ]
  22575. }
  22576. },
  22577. "cache_I.genblk2[3].tag_match_I.agg_out_SB_LUT4_I2_O_SB_LUT4_O": {
  22578. "hide_name": 0,
  22579. "type": "SB_LUT4",
  22580. "parameters": {
  22581. "LUT_INIT": "0001001101011111"
  22582. },
  22583. "attributes": {
  22584. "module_not_derived": "00000000000000000000000000000001",
  22585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  22586. },
  22587. "port_directions": {
  22588. "I0": "input",
  22589. "I1": "input",
  22590. "I2": "input",
  22591. "I3": "input",
  22592. "O": "output"
  22593. },
  22594. "connections": {
  22595. "I0": [ 384 ],
  22596. "I1": [ 390 ],
  22597. "I2": [ 204 ],
  22598. "I3": [ 205 ],
  22599. "O": [ 607 ]
  22600. }
  22601. },
  22602. "cache_I.genblk2[3].tag_match_I.genblk1[0].lut_cmp_I": {
  22603. "hide_name": 0,
  22604. "type": "SB_LUT4",
  22605. "parameters": {
  22606. "LUT_INIT": "1001000000001001"
  22607. },
  22608. "attributes": {
  22609. "hdlname": "cache_I genblk2[3].tag_match_I genblk1[0].lut_cmp_I",
  22610. "module_not_derived": "00000000000000000000000000000001",
  22611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22612. },
  22613. "port_directions": {
  22614. "I0": "input",
  22615. "I1": "input",
  22616. "I2": "input",
  22617. "I3": "input",
  22618. "O": "output"
  22619. },
  22620. "connections": {
  22621. "I0": [ 479 ],
  22622. "I1": [ 301 ],
  22623. "I2": [ 478 ],
  22624. "I3": [ 389 ],
  22625. "O": [ 632 ]
  22626. }
  22627. },
  22628. "cache_I.genblk2[3].tag_match_I.genblk1[1].lut_cmp_I": {
  22629. "hide_name": 0,
  22630. "type": "SB_LUT4",
  22631. "parameters": {
  22632. "LUT_INIT": "1001000000001001"
  22633. },
  22634. "attributes": {
  22635. "hdlname": "cache_I genblk2[3].tag_match_I genblk1[1].lut_cmp_I",
  22636. "module_not_derived": "00000000000000000000000000000001",
  22637. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22638. },
  22639. "port_directions": {
  22640. "I0": "input",
  22641. "I1": "input",
  22642. "I2": "input",
  22643. "I3": "input",
  22644. "O": "output"
  22645. },
  22646. "connections": {
  22647. "I0": [ 477 ],
  22648. "I1": [ 303 ],
  22649. "I2": [ 476 ],
  22650. "I3": [ 312 ],
  22651. "O": [ 633 ]
  22652. }
  22653. },
  22654. "cache_I.genblk2[3].tag_match_I.genblk1[2].lut_cmp_I": {
  22655. "hide_name": 0,
  22656. "type": "SB_LUT4",
  22657. "parameters": {
  22658. "LUT_INIT": "1001000000001001"
  22659. },
  22660. "attributes": {
  22661. "hdlname": "cache_I genblk2[3].tag_match_I genblk1[2].lut_cmp_I",
  22662. "module_not_derived": "00000000000000000000000000000001",
  22663. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22664. },
  22665. "port_directions": {
  22666. "I0": "input",
  22667. "I1": "input",
  22668. "I2": "input",
  22669. "I3": "input",
  22670. "O": "output"
  22671. },
  22672. "connections": {
  22673. "I0": [ 475 ],
  22674. "I1": [ 318 ],
  22675. "I2": [ 474 ],
  22676. "I3": [ 323 ],
  22677. "O": [ 634 ]
  22678. }
  22679. },
  22680. "cache_I.genblk2[3].tag_match_I.genblk1[3].lut_cmp_I": {
  22681. "hide_name": 0,
  22682. "type": "SB_LUT4",
  22683. "parameters": {
  22684. "LUT_INIT": "1001000000001001"
  22685. },
  22686. "attributes": {
  22687. "hdlname": "cache_I genblk2[3].tag_match_I genblk1[3].lut_cmp_I",
  22688. "module_not_derived": "00000000000000000000000000000001",
  22689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22690. },
  22691. "port_directions": {
  22692. "I0": "input",
  22693. "I1": "input",
  22694. "I2": "input",
  22695. "I3": "input",
  22696. "O": "output"
  22697. },
  22698. "connections": {
  22699. "I0": [ 485 ],
  22700. "I1": [ 331 ],
  22701. "I2": [ 484 ],
  22702. "I3": [ 340 ],
  22703. "O": [ 635 ]
  22704. }
  22705. },
  22706. "cache_I.genblk2[3].tag_match_I.genblk1[4].lut_cmp_I": {
  22707. "hide_name": 0,
  22708. "type": "SB_LUT4",
  22709. "parameters": {
  22710. "LUT_INIT": "1001000000001001"
  22711. },
  22712. "attributes": {
  22713. "hdlname": "cache_I genblk2[3].tag_match_I genblk1[4].lut_cmp_I",
  22714. "module_not_derived": "00000000000000000000000000000001",
  22715. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22716. },
  22717. "port_directions": {
  22718. "I0": "input",
  22719. "I1": "input",
  22720. "I2": "input",
  22721. "I3": "input",
  22722. "O": "output"
  22723. },
  22724. "connections": {
  22725. "I0": [ 483 ],
  22726. "I1": [ 347 ],
  22727. "I2": [ 482 ],
  22728. "I3": [ 351 ],
  22729. "O": [ 636 ]
  22730. }
  22731. },
  22732. "cache_I.genblk2[3].tag_match_I.genblk1[5].lut_cmp_I": {
  22733. "hide_name": 0,
  22734. "type": "SB_LUT4",
  22735. "parameters": {
  22736. "LUT_INIT": "1001000000001001"
  22737. },
  22738. "attributes": {
  22739. "hdlname": "cache_I genblk2[3].tag_match_I genblk1[5].lut_cmp_I",
  22740. "module_not_derived": "00000000000000000000000000000001",
  22741. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:53.6-59.5"
  22742. },
  22743. "port_directions": {
  22744. "I0": "input",
  22745. "I1": "input",
  22746. "I2": "input",
  22747. "I3": "input",
  22748. "O": "output"
  22749. },
  22750. "connections": {
  22751. "I0": [ 481 ],
  22752. "I1": [ 361 ],
  22753. "I2": [ 480 ],
  22754. "I3": [ 292 ],
  22755. "O": [ 637 ]
  22756. }
  22757. },
  22758. "cache_I.genblk2[3].tag_match_I.genblk2[0].lut_cmp_I": {
  22759. "hide_name": 0,
  22760. "type": "SB_LUT4",
  22761. "parameters": {
  22762. "LUT_INIT": "1000000000000000"
  22763. },
  22764. "attributes": {
  22765. "hdlname": "cache_I genblk2[3].tag_match_I genblk2[0].lut_cmp_I",
  22766. "module_not_derived": "00000000000000000000000000000001",
  22767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22768. },
  22769. "port_directions": {
  22770. "I0": "input",
  22771. "I1": "input",
  22772. "I2": "input",
  22773. "I3": "input",
  22774. "O": "output"
  22775. },
  22776. "connections": {
  22777. "I0": [ 635 ],
  22778. "I1": [ 634 ],
  22779. "I2": [ 633 ],
  22780. "I3": [ 632 ],
  22781. "O": [ 631 ]
  22782. }
  22783. },
  22784. "cache_I.genblk2[3].tag_match_I.genblk2[1].lut_cmp_I": {
  22785. "hide_name": 0,
  22786. "type": "SB_LUT4",
  22787. "parameters": {
  22788. "LUT_INIT": "1000000000000000"
  22789. },
  22790. "attributes": {
  22791. "hdlname": "cache_I genblk2[3].tag_match_I genblk2[1].lut_cmp_I",
  22792. "module_not_derived": "00000000000000000000000000000001",
  22793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:74.6-80.5"
  22794. },
  22795. "port_directions": {
  22796. "I0": "input",
  22797. "I1": "input",
  22798. "I2": "input",
  22799. "I3": "input",
  22800. "O": "output"
  22801. },
  22802. "connections": {
  22803. "I0": [ "1" ],
  22804. "I1": [ 381 ],
  22805. "I2": [ 637 ],
  22806. "I3": [ 636 ],
  22807. "O": [ 630 ]
  22808. }
  22809. },
  22810. "cache_I.lu_hit_SB_DFFR_D": {
  22811. "hide_name": 0,
  22812. "type": "SB_DFFR",
  22813. "parameters": {
  22814. },
  22815. "attributes": {
  22816. "module_not_derived": "00000000000000000000000000000001",
  22817. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:503.2-510.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  22818. },
  22819. "port_directions": {
  22820. "C": "input",
  22821. "D": "input",
  22822. "Q": "output",
  22823. "R": "input"
  22824. },
  22825. "connections": {
  22826. "C": [ 42 ],
  22827. "D": [ 464 ],
  22828. "Q": [ 638 ],
  22829. "R": [ 127 ]
  22830. }
  22831. },
  22832. "cache_I.lu_hit_SB_LUT4_O": {
  22833. "hide_name": 0,
  22834. "type": "SB_LUT4",
  22835. "parameters": {
  22836. "LUT_INIT": "0000000000001111"
  22837. },
  22838. "attributes": {
  22839. "module_not_derived": "00000000000000000000000000000001",
  22840. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  22841. },
  22842. "port_directions": {
  22843. "I0": "input",
  22844. "I1": "input",
  22845. "I2": "input",
  22846. "I3": "input",
  22847. "O": "output"
  22848. },
  22849. "connections": {
  22850. "I0": [ "0" ],
  22851. "I1": [ "0" ],
  22852. "I2": [ 135 ],
  22853. "I3": [ 232 ],
  22854. "O": [ 464 ]
  22855. }
  22856. },
  22857. "cache_I.mi_ready_SB_DFF_Q": {
  22858. "hide_name": 0,
  22859. "type": "SB_DFF",
  22860. "parameters": {
  22861. },
  22862. "attributes": {
  22863. "module_not_derived": "00000000000000000000000000000001",
  22864. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  22865. },
  22866. "port_directions": {
  22867. "C": "input",
  22868. "D": "input",
  22869. "Q": "output"
  22870. },
  22871. "connections": {
  22872. "C": [ 42 ],
  22873. "D": [ 639 ],
  22874. "Q": [ 133 ]
  22875. }
  22876. },
  22877. "cache_I.mi_rlast_SB_DFF_Q": {
  22878. "hide_name": 0,
  22879. "type": "SB_DFF",
  22880. "parameters": {
  22881. },
  22882. "attributes": {
  22883. "module_not_derived": "00000000000000000000000000000001",
  22884. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:63.4-64.22|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  22885. },
  22886. "port_directions": {
  22887. "C": "input",
  22888. "D": "input",
  22889. "Q": "output"
  22890. },
  22891. "connections": {
  22892. "C": [ 42 ],
  22893. "D": [ 640 ],
  22894. "Q": [ 641 ]
  22895. }
  22896. },
  22897. "cache_I.mi_rlast_SB_LUT4_I1": {
  22898. "hide_name": 0,
  22899. "type": "SB_LUT4",
  22900. "parameters": {
  22901. "LUT_INIT": "0111000000000000"
  22902. },
  22903. "attributes": {
  22904. "module_not_derived": "00000000000000000000000000000001",
  22905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  22906. },
  22907. "port_directions": {
  22908. "I0": "input",
  22909. "I1": "input",
  22910. "I2": "input",
  22911. "I3": "input",
  22912. "O": "output"
  22913. },
  22914. "connections": {
  22915. "I0": [ 230 ],
  22916. "I1": [ 641 ],
  22917. "I2": [ 123 ],
  22918. "I3": [ 124 ],
  22919. "O": [ 134 ]
  22920. }
  22921. },
  22922. "cache_I.mi_rlast_SB_LUT4_I3": {
  22923. "hide_name": 0,
  22924. "type": "SB_LUT4",
  22925. "parameters": {
  22926. "LUT_INIT": "0000111100000000"
  22927. },
  22928. "attributes": {
  22929. "module_not_derived": "00000000000000000000000000000001",
  22930. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  22931. },
  22932. "port_directions": {
  22933. "I0": "input",
  22934. "I1": "input",
  22935. "I2": "input",
  22936. "I3": "input",
  22937. "O": "output"
  22938. },
  22939. "connections": {
  22940. "I0": [ "0" ],
  22941. "I1": [ "0" ],
  22942. "I2": [ 230 ],
  22943. "I3": [ 641 ],
  22944. "O": [ 642 ]
  22945. }
  22946. },
  22947. "cache_I.mi_rlast_SB_LUT4_I3_O_SB_DFFER_Q": {
  22948. "hide_name": 0,
  22949. "type": "SB_DFFER",
  22950. "parameters": {
  22951. },
  22952. "attributes": {
  22953. "module_not_derived": "00000000000000000000000000000001",
  22954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:64.4-68.60|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  22955. },
  22956. "port_directions": {
  22957. "C": "input",
  22958. "D": "input",
  22959. "E": "input",
  22960. "Q": "output",
  22961. "R": "input"
  22962. },
  22963. "connections": {
  22964. "C": [ 42 ],
  22965. "D": [ 643 ],
  22966. "E": [ 644 ],
  22967. "Q": [ 645 ],
  22968. "R": [ 127 ]
  22969. }
  22970. },
  22971. "cache_I.mi_rstb_SB_DFF_Q": {
  22972. "hide_name": 0,
  22973. "type": "SB_DFF",
  22974. "parameters": {
  22975. },
  22976. "attributes": {
  22977. "module_not_derived": "00000000000000000000000000000001",
  22978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:63.4-64.22|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  22979. },
  22980. "port_directions": {
  22981. "C": "input",
  22982. "D": "input",
  22983. "Q": "output"
  22984. },
  22985. "connections": {
  22986. "C": [ 42 ],
  22987. "D": [ 646 ],
  22988. "Q": [ 230 ]
  22989. }
  22990. },
  22991. "cache_I.mi_rstb_SB_LUT4_I0": {
  22992. "hide_name": 0,
  22993. "type": "SB_LUT4",
  22994. "parameters": {
  22995. "LUT_INIT": "0000000000010101"
  22996. },
  22997. "attributes": {
  22998. "module_not_derived": "00000000000000000000000000000001",
  22999. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23000. },
  23001. "port_directions": {
  23002. "I0": "input",
  23003. "I1": "input",
  23004. "I2": "input",
  23005. "I3": "input",
  23006. "O": "output"
  23007. },
  23008. "connections": {
  23009. "I0": [ 230 ],
  23010. "I1": [ 133 ],
  23011. "I2": [ 647 ],
  23012. "I3": [ 122 ],
  23013. "O": [ 116 ]
  23014. }
  23015. },
  23016. "cache_I.mi_rstb_SB_LUT4_I0_I2_SB_LUT4_O": {
  23017. "hide_name": 0,
  23018. "type": "SB_LUT4",
  23019. "parameters": {
  23020. "LUT_INIT": "0000111100000000"
  23021. },
  23022. "attributes": {
  23023. "module_not_derived": "00000000000000000000000000000001",
  23024. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  23025. },
  23026. "port_directions": {
  23027. "I0": "input",
  23028. "I1": "input",
  23029. "I2": "input",
  23030. "I3": "input",
  23031. "O": "output"
  23032. },
  23033. "connections": {
  23034. "I0": [ "0" ],
  23035. "I1": [ "0" ],
  23036. "I2": [ 123 ],
  23037. "I3": [ 124 ],
  23038. "O": [ 647 ]
  23039. }
  23040. },
  23041. "cache_I.mi_wlast_SB_DFFESR_Q": {
  23042. "hide_name": 0,
  23043. "type": "SB_DFFESR",
  23044. "parameters": {
  23045. },
  23046. "attributes": {
  23047. "module_not_derived": "00000000000000000000000000000001",
  23048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  23049. },
  23050. "port_directions": {
  23051. "C": "input",
  23052. "D": "input",
  23053. "E": "input",
  23054. "Q": "output",
  23055. "R": "input"
  23056. },
  23057. "connections": {
  23058. "C": [ 42 ],
  23059. "D": [ 648 ],
  23060. "E": [ 649 ],
  23061. "Q": [ 120 ],
  23062. "R": [ 133 ]
  23063. }
  23064. },
  23065. "cache_I.mi_wlast_SB_LUT4_I1": {
  23066. "hide_name": 0,
  23067. "type": "SB_LUT4",
  23068. "parameters": {
  23069. "LUT_INIT": "0110100110010110"
  23070. },
  23071. "attributes": {
  23072. "module_not_derived": "00000000000000000000000000000001",
  23073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23074. },
  23075. "port_directions": {
  23076. "I0": "input",
  23077. "I1": "input",
  23078. "I2": "input",
  23079. "I3": "input",
  23080. "O": "output"
  23081. },
  23082. "connections": {
  23083. "I0": [ "0" ],
  23084. "I1": [ 120 ],
  23085. "I2": [ "1" ],
  23086. "I3": [ 650 ],
  23087. "O": [ 648 ]
  23088. }
  23089. },
  23090. "cache_I.mi_wlast_SB_LUT4_I1_I3_SB_CARRY_CO": {
  23091. "hide_name": 0,
  23092. "type": "SB_CARRY",
  23093. "parameters": {
  23094. },
  23095. "attributes": {
  23096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  23097. },
  23098. "port_directions": {
  23099. "CI": "input",
  23100. "CO": "output",
  23101. "I0": "input",
  23102. "I1": "input"
  23103. },
  23104. "connections": {
  23105. "CI": [ 651 ],
  23106. "CO": [ 650 ],
  23107. "I0": [ 652 ],
  23108. "I1": [ "1" ]
  23109. }
  23110. },
  23111. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O": {
  23112. "hide_name": 0,
  23113. "type": "SB_LUT4",
  23114. "parameters": {
  23115. "LUT_INIT": "0110100110010110"
  23116. },
  23117. "attributes": {
  23118. "module_not_derived": "00000000000000000000000000000001",
  23119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23120. },
  23121. "port_directions": {
  23122. "I0": "input",
  23123. "I1": "input",
  23124. "I2": "input",
  23125. "I3": "input",
  23126. "O": "output"
  23127. },
  23128. "connections": {
  23129. "I0": [ "0" ],
  23130. "I1": [ 653 ],
  23131. "I2": [ "1" ],
  23132. "I3": [ 654 ],
  23133. "O": [ 655 ]
  23134. }
  23135. },
  23136. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_1": {
  23137. "hide_name": 0,
  23138. "type": "SB_LUT4",
  23139. "parameters": {
  23140. "LUT_INIT": "0110100110010110"
  23141. },
  23142. "attributes": {
  23143. "module_not_derived": "00000000000000000000000000000001",
  23144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23145. },
  23146. "port_directions": {
  23147. "I0": "input",
  23148. "I1": "input",
  23149. "I2": "input",
  23150. "I3": "input",
  23151. "O": "output"
  23152. },
  23153. "connections": {
  23154. "I0": [ "0" ],
  23155. "I1": [ 656 ],
  23156. "I2": [ "1" ],
  23157. "I3": [ 657 ],
  23158. "O": [ 658 ]
  23159. }
  23160. },
  23161. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  23162. "hide_name": 0,
  23163. "type": "SB_CARRY",
  23164. "parameters": {
  23165. },
  23166. "attributes": {
  23167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  23168. },
  23169. "port_directions": {
  23170. "CI": "input",
  23171. "CO": "output",
  23172. "I0": "input",
  23173. "I1": "input"
  23174. },
  23175. "connections": {
  23176. "CI": [ 654 ],
  23177. "CO": [ 657 ],
  23178. "I0": [ 653 ],
  23179. "I1": [ "1" ]
  23180. }
  23181. },
  23182. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_2": {
  23183. "hide_name": 0,
  23184. "type": "SB_LUT4",
  23185. "parameters": {
  23186. "LUT_INIT": "0110100110010110"
  23187. },
  23188. "attributes": {
  23189. "module_not_derived": "00000000000000000000000000000001",
  23190. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23191. },
  23192. "port_directions": {
  23193. "I0": "input",
  23194. "I1": "input",
  23195. "I2": "input",
  23196. "I3": "input",
  23197. "O": "output"
  23198. },
  23199. "connections": {
  23200. "I0": [ "0" ],
  23201. "I1": [ 659 ],
  23202. "I2": [ "1" ],
  23203. "I3": [ 660 ],
  23204. "O": [ 661 ]
  23205. }
  23206. },
  23207. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  23208. "hide_name": 0,
  23209. "type": "SB_CARRY",
  23210. "parameters": {
  23211. },
  23212. "attributes": {
  23213. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  23214. },
  23215. "port_directions": {
  23216. "CI": "input",
  23217. "CO": "output",
  23218. "I0": "input",
  23219. "I1": "input"
  23220. },
  23221. "connections": {
  23222. "CI": [ 657 ],
  23223. "CO": [ 660 ],
  23224. "I0": [ 656 ],
  23225. "I1": [ "1" ]
  23226. }
  23227. },
  23228. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_3": {
  23229. "hide_name": 0,
  23230. "type": "SB_LUT4",
  23231. "parameters": {
  23232. "LUT_INIT": "0110100110010110"
  23233. },
  23234. "attributes": {
  23235. "module_not_derived": "00000000000000000000000000000001",
  23236. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23237. },
  23238. "port_directions": {
  23239. "I0": "input",
  23240. "I1": "input",
  23241. "I2": "input",
  23242. "I3": "input",
  23243. "O": "output"
  23244. },
  23245. "connections": {
  23246. "I0": [ "0" ],
  23247. "I1": [ 662 ],
  23248. "I2": [ "1" ],
  23249. "I3": [ 663 ],
  23250. "O": [ 664 ]
  23251. }
  23252. },
  23253. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  23254. "hide_name": 0,
  23255. "type": "SB_CARRY",
  23256. "parameters": {
  23257. },
  23258. "attributes": {
  23259. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  23260. },
  23261. "port_directions": {
  23262. "CI": "input",
  23263. "CO": "output",
  23264. "I0": "input",
  23265. "I1": "input"
  23266. },
  23267. "connections": {
  23268. "CI": [ 660 ],
  23269. "CO": [ 663 ],
  23270. "I0": [ 659 ],
  23271. "I1": [ "1" ]
  23272. }
  23273. },
  23274. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_4": {
  23275. "hide_name": 0,
  23276. "type": "SB_LUT4",
  23277. "parameters": {
  23278. "LUT_INIT": "0110100110010110"
  23279. },
  23280. "attributes": {
  23281. "module_not_derived": "00000000000000000000000000000001",
  23282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23283. },
  23284. "port_directions": {
  23285. "I0": "input",
  23286. "I1": "input",
  23287. "I2": "input",
  23288. "I3": "input",
  23289. "O": "output"
  23290. },
  23291. "connections": {
  23292. "I0": [ "0" ],
  23293. "I1": [ 665 ],
  23294. "I2": [ "1" ],
  23295. "I3": [ 666 ],
  23296. "O": [ 667 ]
  23297. }
  23298. },
  23299. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  23300. "hide_name": 0,
  23301. "type": "SB_CARRY",
  23302. "parameters": {
  23303. },
  23304. "attributes": {
  23305. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  23306. },
  23307. "port_directions": {
  23308. "CI": "input",
  23309. "CO": "output",
  23310. "I0": "input",
  23311. "I1": "input"
  23312. },
  23313. "connections": {
  23314. "CI": [ 663 ],
  23315. "CO": [ 666 ],
  23316. "I0": [ 662 ],
  23317. "I1": [ "1" ]
  23318. }
  23319. },
  23320. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_5": {
  23321. "hide_name": 0,
  23322. "type": "SB_LUT4",
  23323. "parameters": {
  23324. "LUT_INIT": "0110100110010110"
  23325. },
  23326. "attributes": {
  23327. "module_not_derived": "00000000000000000000000000000001",
  23328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  23329. },
  23330. "port_directions": {
  23331. "I0": "input",
  23332. "I1": "input",
  23333. "I2": "input",
  23334. "I3": "input",
  23335. "O": "output"
  23336. },
  23337. "connections": {
  23338. "I0": [ "0" ],
  23339. "I1": [ 652 ],
  23340. "I2": [ "1" ],
  23341. "I3": [ 651 ],
  23342. "O": [ 668 ]
  23343. }
  23344. },
  23345. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  23346. "hide_name": 0,
  23347. "type": "SB_CARRY",
  23348. "parameters": {
  23349. },
  23350. "attributes": {
  23351. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  23352. },
  23353. "port_directions": {
  23354. "CI": "input",
  23355. "CO": "output",
  23356. "I0": "input",
  23357. "I1": "input"
  23358. },
  23359. "connections": {
  23360. "CI": [ 666 ],
  23361. "CO": [ 651 ],
  23362. "I0": [ 665 ],
  23363. "I1": [ "1" ]
  23364. }
  23365. },
  23366. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_6": {
  23367. "hide_name": 0,
  23368. "type": "SB_LUT4",
  23369. "parameters": {
  23370. "LUT_INIT": "0000000011111111"
  23371. },
  23372. "attributes": {
  23373. "module_not_derived": "00000000000000000000000000000001",
  23374. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  23375. },
  23376. "port_directions": {
  23377. "I0": "input",
  23378. "I1": "input",
  23379. "I2": "input",
  23380. "I3": "input",
  23381. "O": "output"
  23382. },
  23383. "connections": {
  23384. "I0": [ "0" ],
  23385. "I1": [ "0" ],
  23386. "I2": [ "0" ],
  23387. "I3": [ 654 ],
  23388. "O": [ 669 ]
  23389. }
  23390. },
  23391. "cache_I.req_addr_SB_DFFE_Q": {
  23392. "hide_name": 0,
  23393. "type": "SB_DFFE",
  23394. "parameters": {
  23395. },
  23396. "attributes": {
  23397. "module_not_derived": "00000000000000000000000000000001",
  23398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23399. },
  23400. "port_directions": {
  23401. "C": "input",
  23402. "D": "input",
  23403. "E": "input",
  23404. "Q": "output"
  23405. },
  23406. "connections": {
  23407. "C": [ 42 ],
  23408. "D": [ 670 ],
  23409. "E": [ 400 ],
  23410. "Q": [ 480 ]
  23411. }
  23412. },
  23413. "cache_I.req_addr_SB_DFFE_Q_1": {
  23414. "hide_name": 0,
  23415. "type": "SB_DFFE",
  23416. "parameters": {
  23417. },
  23418. "attributes": {
  23419. "module_not_derived": "00000000000000000000000000000001",
  23420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23421. },
  23422. "port_directions": {
  23423. "C": "input",
  23424. "D": "input",
  23425. "E": "input",
  23426. "Q": "output"
  23427. },
  23428. "connections": {
  23429. "C": [ 42 ],
  23430. "D": [ 671 ],
  23431. "E": [ 400 ],
  23432. "Q": [ 481 ]
  23433. }
  23434. },
  23435. "cache_I.req_addr_SB_DFFE_Q_10": {
  23436. "hide_name": 0,
  23437. "type": "SB_DFFE",
  23438. "parameters": {
  23439. },
  23440. "attributes": {
  23441. "module_not_derived": "00000000000000000000000000000001",
  23442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23443. },
  23444. "port_directions": {
  23445. "C": "input",
  23446. "D": "input",
  23447. "E": "input",
  23448. "Q": "output"
  23449. },
  23450. "connections": {
  23451. "C": [ 42 ],
  23452. "D": [ 672 ],
  23453. "E": [ 400 ],
  23454. "Q": [ 478 ]
  23455. }
  23456. },
  23457. "cache_I.req_addr_SB_DFFE_Q_11": {
  23458. "hide_name": 0,
  23459. "type": "SB_DFFE",
  23460. "parameters": {
  23461. },
  23462. "attributes": {
  23463. "module_not_derived": "00000000000000000000000000000001",
  23464. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23465. },
  23466. "port_directions": {
  23467. "C": "input",
  23468. "D": "input",
  23469. "E": "input",
  23470. "Q": "output"
  23471. },
  23472. "connections": {
  23473. "C": [ 42 ],
  23474. "D": [ 673 ],
  23475. "E": [ 400 ],
  23476. "Q": [ 479 ]
  23477. }
  23478. },
  23479. "cache_I.req_addr_SB_DFFE_Q_12": {
  23480. "hide_name": 0,
  23481. "type": "SB_DFFE",
  23482. "parameters": {
  23483. },
  23484. "attributes": {
  23485. "module_not_derived": "00000000000000000000000000000001",
  23486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23487. },
  23488. "port_directions": {
  23489. "C": "input",
  23490. "D": "input",
  23491. "E": "input",
  23492. "Q": "output"
  23493. },
  23494. "connections": {
  23495. "C": [ 42 ],
  23496. "D": [ 399 ],
  23497. "E": [ 400 ],
  23498. "Q": [ 160 ]
  23499. }
  23500. },
  23501. "cache_I.req_addr_SB_DFFE_Q_13": {
  23502. "hide_name": 0,
  23503. "type": "SB_DFFE",
  23504. "parameters": {
  23505. },
  23506. "attributes": {
  23507. "module_not_derived": "00000000000000000000000000000001",
  23508. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23509. },
  23510. "port_directions": {
  23511. "C": "input",
  23512. "D": "input",
  23513. "E": "input",
  23514. "Q": "output"
  23515. },
  23516. "connections": {
  23517. "C": [ 42 ],
  23518. "D": [ 398 ],
  23519. "E": [ 400 ],
  23520. "Q": [ 159 ]
  23521. }
  23522. },
  23523. "cache_I.req_addr_SB_DFFE_Q_14": {
  23524. "hide_name": 0,
  23525. "type": "SB_DFFE",
  23526. "parameters": {
  23527. },
  23528. "attributes": {
  23529. "module_not_derived": "00000000000000000000000000000001",
  23530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23531. },
  23532. "port_directions": {
  23533. "C": "input",
  23534. "D": "input",
  23535. "E": "input",
  23536. "Q": "output"
  23537. },
  23538. "connections": {
  23539. "C": [ 42 ],
  23540. "D": [ 397 ],
  23541. "E": [ 400 ],
  23542. "Q": [ 158 ]
  23543. }
  23544. },
  23545. "cache_I.req_addr_SB_DFFE_Q_15": {
  23546. "hide_name": 0,
  23547. "type": "SB_DFFE",
  23548. "parameters": {
  23549. },
  23550. "attributes": {
  23551. "module_not_derived": "00000000000000000000000000000001",
  23552. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23553. },
  23554. "port_directions": {
  23555. "C": "input",
  23556. "D": "input",
  23557. "E": "input",
  23558. "Q": "output"
  23559. },
  23560. "connections": {
  23561. "C": [ 42 ],
  23562. "D": [ 396 ],
  23563. "E": [ 400 ],
  23564. "Q": [ 157 ]
  23565. }
  23566. },
  23567. "cache_I.req_addr_SB_DFFE_Q_16": {
  23568. "hide_name": 0,
  23569. "type": "SB_DFFE",
  23570. "parameters": {
  23571. },
  23572. "attributes": {
  23573. "module_not_derived": "00000000000000000000000000000001",
  23574. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23575. },
  23576. "port_directions": {
  23577. "C": "input",
  23578. "D": "input",
  23579. "E": "input",
  23580. "Q": "output"
  23581. },
  23582. "connections": {
  23583. "C": [ 42 ],
  23584. "D": [ 41 ],
  23585. "E": [ 400 ],
  23586. "Q": [ 156 ]
  23587. }
  23588. },
  23589. "cache_I.req_addr_SB_DFFE_Q_17": {
  23590. "hide_name": 0,
  23591. "type": "SB_DFFE",
  23592. "parameters": {
  23593. },
  23594. "attributes": {
  23595. "module_not_derived": "00000000000000000000000000000001",
  23596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23597. },
  23598. "port_directions": {
  23599. "C": "input",
  23600. "D": "input",
  23601. "E": "input",
  23602. "Q": "output"
  23603. },
  23604. "connections": {
  23605. "C": [ 42 ],
  23606. "D": [ 40 ],
  23607. "E": [ 400 ],
  23608. "Q": [ 155 ]
  23609. }
  23610. },
  23611. "cache_I.req_addr_SB_DFFE_Q_18": {
  23612. "hide_name": 0,
  23613. "type": "SB_DFFE",
  23614. "parameters": {
  23615. },
  23616. "attributes": {
  23617. "module_not_derived": "00000000000000000000000000000001",
  23618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23619. },
  23620. "port_directions": {
  23621. "C": "input",
  23622. "D": "input",
  23623. "E": "input",
  23624. "Q": "output"
  23625. },
  23626. "connections": {
  23627. "C": [ 42 ],
  23628. "D": [ 39 ],
  23629. "E": [ 400 ],
  23630. "Q": [ 154 ]
  23631. }
  23632. },
  23633. "cache_I.req_addr_SB_DFFE_Q_19": {
  23634. "hide_name": 0,
  23635. "type": "SB_DFFE",
  23636. "parameters": {
  23637. },
  23638. "attributes": {
  23639. "module_not_derived": "00000000000000000000000000000001",
  23640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23641. },
  23642. "port_directions": {
  23643. "C": "input",
  23644. "D": "input",
  23645. "E": "input",
  23646. "Q": "output"
  23647. },
  23648. "connections": {
  23649. "C": [ 42 ],
  23650. "D": [ 38 ],
  23651. "E": [ 400 ],
  23652. "Q": [ 153 ]
  23653. }
  23654. },
  23655. "cache_I.req_addr_SB_DFFE_Q_2": {
  23656. "hide_name": 0,
  23657. "type": "SB_DFFE",
  23658. "parameters": {
  23659. },
  23660. "attributes": {
  23661. "module_not_derived": "00000000000000000000000000000001",
  23662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23663. },
  23664. "port_directions": {
  23665. "C": "input",
  23666. "D": "input",
  23667. "E": "input",
  23668. "Q": "output"
  23669. },
  23670. "connections": {
  23671. "C": [ 42 ],
  23672. "D": [ 674 ],
  23673. "E": [ 400 ],
  23674. "Q": [ 482 ]
  23675. }
  23676. },
  23677. "cache_I.req_addr_SB_DFFE_Q_20": {
  23678. "hide_name": 0,
  23679. "type": "SB_DFFE",
  23680. "parameters": {
  23681. },
  23682. "attributes": {
  23683. "module_not_derived": "00000000000000000000000000000001",
  23684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23685. },
  23686. "port_directions": {
  23687. "C": "input",
  23688. "D": "input",
  23689. "E": "input",
  23690. "Q": "output"
  23691. },
  23692. "connections": {
  23693. "C": [ 42 ],
  23694. "D": [ 37 ],
  23695. "E": [ 400 ],
  23696. "Q": [ 152 ]
  23697. }
  23698. },
  23699. "cache_I.req_addr_SB_DFFE_Q_21": {
  23700. "hide_name": 0,
  23701. "type": "SB_DFFE",
  23702. "parameters": {
  23703. },
  23704. "attributes": {
  23705. "module_not_derived": "00000000000000000000000000000001",
  23706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23707. },
  23708. "port_directions": {
  23709. "C": "input",
  23710. "D": "input",
  23711. "E": "input",
  23712. "Q": "output"
  23713. },
  23714. "connections": {
  23715. "C": [ 42 ],
  23716. "D": [ 36 ],
  23717. "E": [ 400 ],
  23718. "Q": [ 206 ]
  23719. }
  23720. },
  23721. "cache_I.req_addr_SB_DFFE_Q_22": {
  23722. "hide_name": 0,
  23723. "type": "SB_DFFE",
  23724. "parameters": {
  23725. },
  23726. "attributes": {
  23727. "module_not_derived": "00000000000000000000000000000001",
  23728. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23729. },
  23730. "port_directions": {
  23731. "C": "input",
  23732. "D": "input",
  23733. "E": "input",
  23734. "Q": "output"
  23735. },
  23736. "connections": {
  23737. "C": [ 42 ],
  23738. "D": [ 35 ],
  23739. "E": [ 400 ],
  23740. "Q": [ 207 ]
  23741. }
  23742. },
  23743. "cache_I.req_addr_SB_DFFE_Q_23": {
  23744. "hide_name": 0,
  23745. "type": "SB_DFFE",
  23746. "parameters": {
  23747. },
  23748. "attributes": {
  23749. "module_not_derived": "00000000000000000000000000000001",
  23750. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23751. },
  23752. "port_directions": {
  23753. "C": "input",
  23754. "D": "input",
  23755. "E": "input",
  23756. "Q": "output"
  23757. },
  23758. "connections": {
  23759. "C": [ 42 ],
  23760. "D": [ 34 ],
  23761. "E": [ 400 ],
  23762. "Q": [ 208 ]
  23763. }
  23764. },
  23765. "cache_I.req_addr_SB_DFFE_Q_3": {
  23766. "hide_name": 0,
  23767. "type": "SB_DFFE",
  23768. "parameters": {
  23769. },
  23770. "attributes": {
  23771. "module_not_derived": "00000000000000000000000000000001",
  23772. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23773. },
  23774. "port_directions": {
  23775. "C": "input",
  23776. "D": "input",
  23777. "E": "input",
  23778. "Q": "output"
  23779. },
  23780. "connections": {
  23781. "C": [ 42 ],
  23782. "D": [ 675 ],
  23783. "E": [ 400 ],
  23784. "Q": [ 483 ]
  23785. }
  23786. },
  23787. "cache_I.req_addr_SB_DFFE_Q_4": {
  23788. "hide_name": 0,
  23789. "type": "SB_DFFE",
  23790. "parameters": {
  23791. },
  23792. "attributes": {
  23793. "module_not_derived": "00000000000000000000000000000001",
  23794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23795. },
  23796. "port_directions": {
  23797. "C": "input",
  23798. "D": "input",
  23799. "E": "input",
  23800. "Q": "output"
  23801. },
  23802. "connections": {
  23803. "C": [ 42 ],
  23804. "D": [ 676 ],
  23805. "E": [ 400 ],
  23806. "Q": [ 484 ]
  23807. }
  23808. },
  23809. "cache_I.req_addr_SB_DFFE_Q_5": {
  23810. "hide_name": 0,
  23811. "type": "SB_DFFE",
  23812. "parameters": {
  23813. },
  23814. "attributes": {
  23815. "module_not_derived": "00000000000000000000000000000001",
  23816. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23817. },
  23818. "port_directions": {
  23819. "C": "input",
  23820. "D": "input",
  23821. "E": "input",
  23822. "Q": "output"
  23823. },
  23824. "connections": {
  23825. "C": [ 42 ],
  23826. "D": [ 677 ],
  23827. "E": [ 400 ],
  23828. "Q": [ 485 ]
  23829. }
  23830. },
  23831. "cache_I.req_addr_SB_DFFE_Q_6": {
  23832. "hide_name": 0,
  23833. "type": "SB_DFFE",
  23834. "parameters": {
  23835. },
  23836. "attributes": {
  23837. "module_not_derived": "00000000000000000000000000000001",
  23838. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23839. },
  23840. "port_directions": {
  23841. "C": "input",
  23842. "D": "input",
  23843. "E": "input",
  23844. "Q": "output"
  23845. },
  23846. "connections": {
  23847. "C": [ 42 ],
  23848. "D": [ 678 ],
  23849. "E": [ 400 ],
  23850. "Q": [ 474 ]
  23851. }
  23852. },
  23853. "cache_I.req_addr_SB_DFFE_Q_7": {
  23854. "hide_name": 0,
  23855. "type": "SB_DFFE",
  23856. "parameters": {
  23857. },
  23858. "attributes": {
  23859. "module_not_derived": "00000000000000000000000000000001",
  23860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23861. },
  23862. "port_directions": {
  23863. "C": "input",
  23864. "D": "input",
  23865. "E": "input",
  23866. "Q": "output"
  23867. },
  23868. "connections": {
  23869. "C": [ 42 ],
  23870. "D": [ 679 ],
  23871. "E": [ 400 ],
  23872. "Q": [ 475 ]
  23873. }
  23874. },
  23875. "cache_I.req_addr_SB_DFFE_Q_8": {
  23876. "hide_name": 0,
  23877. "type": "SB_DFFE",
  23878. "parameters": {
  23879. },
  23880. "attributes": {
  23881. "module_not_derived": "00000000000000000000000000000001",
  23882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23883. },
  23884. "port_directions": {
  23885. "C": "input",
  23886. "D": "input",
  23887. "E": "input",
  23888. "Q": "output"
  23889. },
  23890. "connections": {
  23891. "C": [ 42 ],
  23892. "D": [ 680 ],
  23893. "E": [ 400 ],
  23894. "Q": [ 476 ]
  23895. }
  23896. },
  23897. "cache_I.req_addr_SB_DFFE_Q_9": {
  23898. "hide_name": 0,
  23899. "type": "SB_DFFE",
  23900. "parameters": {
  23901. },
  23902. "attributes": {
  23903. "module_not_derived": "00000000000000000000000000000001",
  23904. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:237.2-239.29|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  23905. },
  23906. "port_directions": {
  23907. "C": "input",
  23908. "D": "input",
  23909. "E": "input",
  23910. "Q": "output"
  23911. },
  23912. "connections": {
  23913. "C": [ 42 ],
  23914. "D": [ 681 ],
  23915. "E": [ 400 ],
  23916. "Q": [ 477 ]
  23917. }
  23918. },
  23919. "cache_I.req_addr_pre_SB_LUT4_O": {
  23920. "hide_name": 0,
  23921. "type": "SB_LUT4",
  23922. "parameters": {
  23923. "LUT_INIT": "1111000011001100"
  23924. },
  23925. "attributes": {
  23926. "module_not_derived": "00000000000000000000000000000001",
  23927. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  23928. },
  23929. "port_directions": {
  23930. "I0": "input",
  23931. "I1": "input",
  23932. "I2": "input",
  23933. "I3": "input",
  23934. "O": "output"
  23935. },
  23936. "connections": {
  23937. "I0": [ "0" ],
  23938. "I1": [ 682 ],
  23939. "I2": [ 683 ],
  23940. "I3": [ 684 ],
  23941. "O": [ 673 ]
  23942. }
  23943. },
  23944. "cache_I.req_addr_pre_SB_LUT4_O_1": {
  23945. "hide_name": 0,
  23946. "type": "SB_LUT4",
  23947. "parameters": {
  23948. "LUT_INIT": "1111000011001100"
  23949. },
  23950. "attributes": {
  23951. "module_not_derived": "00000000000000000000000000000001",
  23952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  23953. },
  23954. "port_directions": {
  23955. "I0": "input",
  23956. "I1": "input",
  23957. "I2": "input",
  23958. "I3": "input",
  23959. "O": "output"
  23960. },
  23961. "connections": {
  23962. "I0": [ "0" ],
  23963. "I1": [ 685 ],
  23964. "I2": [ 686 ],
  23965. "I3": [ 684 ],
  23966. "O": [ 672 ]
  23967. }
  23968. },
  23969. "cache_I.req_addr_pre_SB_LUT4_O_10": {
  23970. "hide_name": 0,
  23971. "type": "SB_LUT4",
  23972. "parameters": {
  23973. "LUT_INIT": "1111000011001100"
  23974. },
  23975. "attributes": {
  23976. "module_not_derived": "00000000000000000000000000000001",
  23977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  23978. },
  23979. "port_directions": {
  23980. "I0": "input",
  23981. "I1": "input",
  23982. "I2": "input",
  23983. "I3": "input",
  23984. "O": "output"
  23985. },
  23986. "connections": {
  23987. "I0": [ "0" ],
  23988. "I1": [ 687 ],
  23989. "I2": [ 688 ],
  23990. "I3": [ 684 ],
  23991. "O": [ 671 ]
  23992. }
  23993. },
  23994. "cache_I.req_addr_pre_SB_LUT4_O_11": {
  23995. "hide_name": 0,
  23996. "type": "SB_LUT4",
  23997. "parameters": {
  23998. "LUT_INIT": "1111000011001100"
  23999. },
  24000. "attributes": {
  24001. "module_not_derived": "00000000000000000000000000000001",
  24002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24003. },
  24004. "port_directions": {
  24005. "I0": "input",
  24006. "I1": "input",
  24007. "I2": "input",
  24008. "I3": "input",
  24009. "O": "output"
  24010. },
  24011. "connections": {
  24012. "I0": [ "0" ],
  24013. "I1": [ 689 ],
  24014. "I2": [ 690 ],
  24015. "I3": [ 684 ],
  24016. "O": [ 670 ]
  24017. }
  24018. },
  24019. "cache_I.req_addr_pre_SB_LUT4_O_12": {
  24020. "hide_name": 0,
  24021. "type": "SB_LUT4",
  24022. "parameters": {
  24023. "LUT_INIT": "1111000011001100"
  24024. },
  24025. "attributes": {
  24026. "module_not_derived": "00000000000000000000000000000001",
  24027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24028. },
  24029. "port_directions": {
  24030. "I0": "input",
  24031. "I1": "input",
  24032. "I2": "input",
  24033. "I3": "input",
  24034. "O": "output"
  24035. },
  24036. "connections": {
  24037. "I0": [ "0" ],
  24038. "I1": [ 691 ],
  24039. "I2": [ 692 ],
  24040. "I3": [ 684 ],
  24041. "O": [ 41 ]
  24042. }
  24043. },
  24044. "cache_I.req_addr_pre_SB_LUT4_O_13": {
  24045. "hide_name": 0,
  24046. "type": "SB_LUT4",
  24047. "parameters": {
  24048. "LUT_INIT": "1111000011001100"
  24049. },
  24050. "attributes": {
  24051. "module_not_derived": "00000000000000000000000000000001",
  24052. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24053. },
  24054. "port_directions": {
  24055. "I0": "input",
  24056. "I1": "input",
  24057. "I2": "input",
  24058. "I3": "input",
  24059. "O": "output"
  24060. },
  24061. "connections": {
  24062. "I0": [ "0" ],
  24063. "I1": [ 693 ],
  24064. "I2": [ 694 ],
  24065. "I3": [ 684 ],
  24066. "O": [ 40 ]
  24067. }
  24068. },
  24069. "cache_I.req_addr_pre_SB_LUT4_O_14": {
  24070. "hide_name": 0,
  24071. "type": "SB_LUT4",
  24072. "parameters": {
  24073. "LUT_INIT": "1111000011001100"
  24074. },
  24075. "attributes": {
  24076. "module_not_derived": "00000000000000000000000000000001",
  24077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24078. },
  24079. "port_directions": {
  24080. "I0": "input",
  24081. "I1": "input",
  24082. "I2": "input",
  24083. "I3": "input",
  24084. "O": "output"
  24085. },
  24086. "connections": {
  24087. "I0": [ "0" ],
  24088. "I1": [ 695 ],
  24089. "I2": [ 696 ],
  24090. "I3": [ 684 ],
  24091. "O": [ 39 ]
  24092. }
  24093. },
  24094. "cache_I.req_addr_pre_SB_LUT4_O_15": {
  24095. "hide_name": 0,
  24096. "type": "SB_LUT4",
  24097. "parameters": {
  24098. "LUT_INIT": "1111000011001100"
  24099. },
  24100. "attributes": {
  24101. "module_not_derived": "00000000000000000000000000000001",
  24102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24103. },
  24104. "port_directions": {
  24105. "I0": "input",
  24106. "I1": "input",
  24107. "I2": "input",
  24108. "I3": "input",
  24109. "O": "output"
  24110. },
  24111. "connections": {
  24112. "I0": [ "0" ],
  24113. "I1": [ 697 ],
  24114. "I2": [ 698 ],
  24115. "I3": [ 684 ],
  24116. "O": [ 38 ]
  24117. }
  24118. },
  24119. "cache_I.req_addr_pre_SB_LUT4_O_16": {
  24120. "hide_name": 0,
  24121. "type": "SB_LUT4",
  24122. "parameters": {
  24123. "LUT_INIT": "1111000011001100"
  24124. },
  24125. "attributes": {
  24126. "module_not_derived": "00000000000000000000000000000001",
  24127. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24128. },
  24129. "port_directions": {
  24130. "I0": "input",
  24131. "I1": "input",
  24132. "I2": "input",
  24133. "I3": "input",
  24134. "O": "output"
  24135. },
  24136. "connections": {
  24137. "I0": [ "0" ],
  24138. "I1": [ 699 ],
  24139. "I2": [ 700 ],
  24140. "I3": [ 684 ],
  24141. "O": [ 37 ]
  24142. }
  24143. },
  24144. "cache_I.req_addr_pre_SB_LUT4_O_17": {
  24145. "hide_name": 0,
  24146. "type": "SB_LUT4",
  24147. "parameters": {
  24148. "LUT_INIT": "0011101100001010"
  24149. },
  24150. "attributes": {
  24151. "module_not_derived": "00000000000000000000000000000001",
  24152. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  24153. },
  24154. "port_directions": {
  24155. "I0": "input",
  24156. "I1": "input",
  24157. "I2": "input",
  24158. "I3": "input",
  24159. "O": "output"
  24160. },
  24161. "connections": {
  24162. "I0": [ 701 ],
  24163. "I1": [ 702 ],
  24164. "I2": [ 684 ],
  24165. "I3": [ 703 ],
  24166. "O": [ 36 ]
  24167. }
  24168. },
  24169. "cache_I.req_addr_pre_SB_LUT4_O_18": {
  24170. "hide_name": 0,
  24171. "type": "SB_LUT4",
  24172. "parameters": {
  24173. "LUT_INIT": "0011101100001010"
  24174. },
  24175. "attributes": {
  24176. "module_not_derived": "00000000000000000000000000000001",
  24177. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  24178. },
  24179. "port_directions": {
  24180. "I0": "input",
  24181. "I1": "input",
  24182. "I2": "input",
  24183. "I3": "input",
  24184. "O": "output"
  24185. },
  24186. "connections": {
  24187. "I0": [ 704 ],
  24188. "I1": [ 702 ],
  24189. "I2": [ 684 ],
  24190. "I3": [ 705 ],
  24191. "O": [ 35 ]
  24192. }
  24193. },
  24194. "cache_I.req_addr_pre_SB_LUT4_O_19": {
  24195. "hide_name": 0,
  24196. "type": "SB_LUT4",
  24197. "parameters": {
  24198. "LUT_INIT": "0011101100001010"
  24199. },
  24200. "attributes": {
  24201. "module_not_derived": "00000000000000000000000000000001",
  24202. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  24203. },
  24204. "port_directions": {
  24205. "I0": "input",
  24206. "I1": "input",
  24207. "I2": "input",
  24208. "I3": "input",
  24209. "O": "output"
  24210. },
  24211. "connections": {
  24212. "I0": [ 706 ],
  24213. "I1": [ 702 ],
  24214. "I2": [ 684 ],
  24215. "I3": [ 707 ],
  24216. "O": [ 34 ]
  24217. }
  24218. },
  24219. "cache_I.req_addr_pre_SB_LUT4_O_2": {
  24220. "hide_name": 0,
  24221. "type": "SB_LUT4",
  24222. "parameters": {
  24223. "LUT_INIT": "1111000011001100"
  24224. },
  24225. "attributes": {
  24226. "module_not_derived": "00000000000000000000000000000001",
  24227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24228. },
  24229. "port_directions": {
  24230. "I0": "input",
  24231. "I1": "input",
  24232. "I2": "input",
  24233. "I3": "input",
  24234. "O": "output"
  24235. },
  24236. "connections": {
  24237. "I0": [ "0" ],
  24238. "I1": [ 708 ],
  24239. "I2": [ 709 ],
  24240. "I3": [ 684 ],
  24241. "O": [ 681 ]
  24242. }
  24243. },
  24244. "cache_I.req_addr_pre_SB_LUT4_O_20": {
  24245. "hide_name": 0,
  24246. "type": "SB_LUT4",
  24247. "parameters": {
  24248. "LUT_INIT": "1111000011001100"
  24249. },
  24250. "attributes": {
  24251. "module_not_derived": "00000000000000000000000000000001",
  24252. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24253. },
  24254. "port_directions": {
  24255. "I0": "input",
  24256. "I1": "input",
  24257. "I2": "input",
  24258. "I3": "input",
  24259. "O": "output"
  24260. },
  24261. "connections": {
  24262. "I0": [ "0" ],
  24263. "I1": [ 710 ],
  24264. "I2": [ 711 ],
  24265. "I3": [ 684 ],
  24266. "O": [ 399 ]
  24267. }
  24268. },
  24269. "cache_I.req_addr_pre_SB_LUT4_O_21": {
  24270. "hide_name": 0,
  24271. "type": "SB_LUT4",
  24272. "parameters": {
  24273. "LUT_INIT": "1111000011001100"
  24274. },
  24275. "attributes": {
  24276. "module_not_derived": "00000000000000000000000000000001",
  24277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24278. },
  24279. "port_directions": {
  24280. "I0": "input",
  24281. "I1": "input",
  24282. "I2": "input",
  24283. "I3": "input",
  24284. "O": "output"
  24285. },
  24286. "connections": {
  24287. "I0": [ "0" ],
  24288. "I1": [ 712 ],
  24289. "I2": [ 713 ],
  24290. "I3": [ 684 ],
  24291. "O": [ 398 ]
  24292. }
  24293. },
  24294. "cache_I.req_addr_pre_SB_LUT4_O_22": {
  24295. "hide_name": 0,
  24296. "type": "SB_LUT4",
  24297. "parameters": {
  24298. "LUT_INIT": "1111000011001100"
  24299. },
  24300. "attributes": {
  24301. "module_not_derived": "00000000000000000000000000000001",
  24302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24303. },
  24304. "port_directions": {
  24305. "I0": "input",
  24306. "I1": "input",
  24307. "I2": "input",
  24308. "I3": "input",
  24309. "O": "output"
  24310. },
  24311. "connections": {
  24312. "I0": [ "0" ],
  24313. "I1": [ 714 ],
  24314. "I2": [ 715 ],
  24315. "I3": [ 684 ],
  24316. "O": [ 397 ]
  24317. }
  24318. },
  24319. "cache_I.req_addr_pre_SB_LUT4_O_23": {
  24320. "hide_name": 0,
  24321. "type": "SB_LUT4",
  24322. "parameters": {
  24323. "LUT_INIT": "1111000011001100"
  24324. },
  24325. "attributes": {
  24326. "module_not_derived": "00000000000000000000000000000001",
  24327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24328. },
  24329. "port_directions": {
  24330. "I0": "input",
  24331. "I1": "input",
  24332. "I2": "input",
  24333. "I3": "input",
  24334. "O": "output"
  24335. },
  24336. "connections": {
  24337. "I0": [ "0" ],
  24338. "I1": [ 716 ],
  24339. "I2": [ 717 ],
  24340. "I3": [ 684 ],
  24341. "O": [ 396 ]
  24342. }
  24343. },
  24344. "cache_I.req_addr_pre_SB_LUT4_O_3": {
  24345. "hide_name": 0,
  24346. "type": "SB_LUT4",
  24347. "parameters": {
  24348. "LUT_INIT": "1111000011001100"
  24349. },
  24350. "attributes": {
  24351. "module_not_derived": "00000000000000000000000000000001",
  24352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24353. },
  24354. "port_directions": {
  24355. "I0": "input",
  24356. "I1": "input",
  24357. "I2": "input",
  24358. "I3": "input",
  24359. "O": "output"
  24360. },
  24361. "connections": {
  24362. "I0": [ "0" ],
  24363. "I1": [ 718 ],
  24364. "I2": [ 719 ],
  24365. "I3": [ 684 ],
  24366. "O": [ 680 ]
  24367. }
  24368. },
  24369. "cache_I.req_addr_pre_SB_LUT4_O_4": {
  24370. "hide_name": 0,
  24371. "type": "SB_LUT4",
  24372. "parameters": {
  24373. "LUT_INIT": "1111000011001100"
  24374. },
  24375. "attributes": {
  24376. "module_not_derived": "00000000000000000000000000000001",
  24377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24378. },
  24379. "port_directions": {
  24380. "I0": "input",
  24381. "I1": "input",
  24382. "I2": "input",
  24383. "I3": "input",
  24384. "O": "output"
  24385. },
  24386. "connections": {
  24387. "I0": [ "0" ],
  24388. "I1": [ 720 ],
  24389. "I2": [ 721 ],
  24390. "I3": [ 684 ],
  24391. "O": [ 679 ]
  24392. }
  24393. },
  24394. "cache_I.req_addr_pre_SB_LUT4_O_5": {
  24395. "hide_name": 0,
  24396. "type": "SB_LUT4",
  24397. "parameters": {
  24398. "LUT_INIT": "1111000011001100"
  24399. },
  24400. "attributes": {
  24401. "module_not_derived": "00000000000000000000000000000001",
  24402. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24403. },
  24404. "port_directions": {
  24405. "I0": "input",
  24406. "I1": "input",
  24407. "I2": "input",
  24408. "I3": "input",
  24409. "O": "output"
  24410. },
  24411. "connections": {
  24412. "I0": [ "0" ],
  24413. "I1": [ 722 ],
  24414. "I2": [ 723 ],
  24415. "I3": [ 684 ],
  24416. "O": [ 678 ]
  24417. }
  24418. },
  24419. "cache_I.req_addr_pre_SB_LUT4_O_6": {
  24420. "hide_name": 0,
  24421. "type": "SB_LUT4",
  24422. "parameters": {
  24423. "LUT_INIT": "1111000011001100"
  24424. },
  24425. "attributes": {
  24426. "module_not_derived": "00000000000000000000000000000001",
  24427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24428. },
  24429. "port_directions": {
  24430. "I0": "input",
  24431. "I1": "input",
  24432. "I2": "input",
  24433. "I3": "input",
  24434. "O": "output"
  24435. },
  24436. "connections": {
  24437. "I0": [ "0" ],
  24438. "I1": [ 724 ],
  24439. "I2": [ 725 ],
  24440. "I3": [ 684 ],
  24441. "O": [ 677 ]
  24442. }
  24443. },
  24444. "cache_I.req_addr_pre_SB_LUT4_O_7": {
  24445. "hide_name": 0,
  24446. "type": "SB_LUT4",
  24447. "parameters": {
  24448. "LUT_INIT": "1111000011001100"
  24449. },
  24450. "attributes": {
  24451. "module_not_derived": "00000000000000000000000000000001",
  24452. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24453. },
  24454. "port_directions": {
  24455. "I0": "input",
  24456. "I1": "input",
  24457. "I2": "input",
  24458. "I3": "input",
  24459. "O": "output"
  24460. },
  24461. "connections": {
  24462. "I0": [ "0" ],
  24463. "I1": [ 726 ],
  24464. "I2": [ 727 ],
  24465. "I3": [ 684 ],
  24466. "O": [ 676 ]
  24467. }
  24468. },
  24469. "cache_I.req_addr_pre_SB_LUT4_O_8": {
  24470. "hide_name": 0,
  24471. "type": "SB_LUT4",
  24472. "parameters": {
  24473. "LUT_INIT": "1111000011001100"
  24474. },
  24475. "attributes": {
  24476. "module_not_derived": "00000000000000000000000000000001",
  24477. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24478. },
  24479. "port_directions": {
  24480. "I0": "input",
  24481. "I1": "input",
  24482. "I2": "input",
  24483. "I3": "input",
  24484. "O": "output"
  24485. },
  24486. "connections": {
  24487. "I0": [ "0" ],
  24488. "I1": [ 728 ],
  24489. "I2": [ 729 ],
  24490. "I3": [ 684 ],
  24491. "O": [ 675 ]
  24492. }
  24493. },
  24494. "cache_I.req_addr_pre_SB_LUT4_O_9": {
  24495. "hide_name": 0,
  24496. "type": "SB_LUT4",
  24497. "parameters": {
  24498. "LUT_INIT": "1111000011001100"
  24499. },
  24500. "attributes": {
  24501. "module_not_derived": "00000000000000000000000000000001",
  24502. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24503. },
  24504. "port_directions": {
  24505. "I0": "input",
  24506. "I1": "input",
  24507. "I2": "input",
  24508. "I3": "input",
  24509. "O": "output"
  24510. },
  24511. "connections": {
  24512. "I0": [ "0" ],
  24513. "I1": [ 730 ],
  24514. "I2": [ 731 ],
  24515. "I3": [ 684 ],
  24516. "O": [ 674 ]
  24517. }
  24518. },
  24519. "cache_bus_I.ctrl_is_cache_SB_DFFE_Q": {
  24520. "hide_name": 0,
  24521. "type": "SB_DFFE",
  24522. "parameters": {
  24523. },
  24524. "attributes": {
  24525. "module_not_derived": "00000000000000000000000000000001",
  24526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:175.2-184.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  24527. },
  24528. "port_directions": {
  24529. "C": "input",
  24530. "D": "input",
  24531. "E": "input",
  24532. "Q": "output"
  24533. },
  24534. "connections": {
  24535. "C": [ 42 ],
  24536. "D": [ 732 ],
  24537. "E": [ 733 ],
  24538. "Q": [ 734 ]
  24539. }
  24540. },
  24541. "cache_bus_I.ctrl_is_cache_SB_DFFE_Q_D_SB_LUT4_O": {
  24542. "hide_name": 0,
  24543. "type": "SB_LUT4",
  24544. "parameters": {
  24545. "LUT_INIT": "1111000001000100"
  24546. },
  24547. "attributes": {
  24548. "module_not_derived": "00000000000000000000000000000001",
  24549. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  24550. },
  24551. "port_directions": {
  24552. "I0": "input",
  24553. "I1": "input",
  24554. "I2": "input",
  24555. "I3": "input",
  24556. "O": "output"
  24557. },
  24558. "connections": {
  24559. "I0": [ 735 ],
  24560. "I1": [ 736 ],
  24561. "I2": [ 737 ],
  24562. "I3": [ 738 ],
  24563. "O": [ 732 ]
  24564. }
  24565. },
  24566. "cache_bus_I.ctrl_is_dbus_SB_DFFE_Q": {
  24567. "hide_name": 0,
  24568. "type": "SB_DFFE",
  24569. "parameters": {
  24570. },
  24571. "attributes": {
  24572. "module_not_derived": "00000000000000000000000000000001",
  24573. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:175.2-184.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  24574. },
  24575. "port_directions": {
  24576. "C": "input",
  24577. "D": "input",
  24578. "E": "input",
  24579. "Q": "output"
  24580. },
  24581. "connections": {
  24582. "C": [ 42 ],
  24583. "D": [ 739 ],
  24584. "E": [ 733 ],
  24585. "Q": [ 702 ]
  24586. }
  24587. },
  24588. "cache_bus_I.ctrl_is_dbus_SB_DFFE_Q_D_SB_LUT4_O": {
  24589. "hide_name": 0,
  24590. "type": "SB_LUT4",
  24591. "parameters": {
  24592. "LUT_INIT": "0000000011110000"
  24593. },
  24594. "attributes": {
  24595. "module_not_derived": "00000000000000000000000000000001",
  24596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  24597. },
  24598. "port_directions": {
  24599. "I0": "input",
  24600. "I1": "input",
  24601. "I2": "input",
  24602. "I3": "input",
  24603. "O": "output"
  24604. },
  24605. "connections": {
  24606. "I0": [ "0" ],
  24607. "I1": [ "0" ],
  24608. "I2": [ 740 ],
  24609. "I3": [ 738 ],
  24610. "O": [ 739 ]
  24611. }
  24612. },
  24613. "cache_bus_I.ctrl_is_dbus_SB_LUT4_I2": {
  24614. "hide_name": 0,
  24615. "type": "SB_LUT4",
  24616. "parameters": {
  24617. "LUT_INIT": "1100111100000011"
  24618. },
  24619. "attributes": {
  24620. "module_not_derived": "00000000000000000000000000000001",
  24621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24622. },
  24623. "port_directions": {
  24624. "I0": "input",
  24625. "I1": "input",
  24626. "I2": "input",
  24627. "I3": "input",
  24628. "O": "output"
  24629. },
  24630. "connections": {
  24631. "I0": [ "0" ],
  24632. "I1": [ 733 ],
  24633. "I2": [ 702 ],
  24634. "I3": [ 738 ],
  24635. "O": [ 684 ]
  24636. }
  24637. },
  24638. "cache_bus_I.ctrl_is_ibus_SB_DFFE_Q": {
  24639. "hide_name": 0,
  24640. "type": "SB_DFFE",
  24641. "parameters": {
  24642. },
  24643. "attributes": {
  24644. "module_not_derived": "00000000000000000000000000000001",
  24645. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:175.2-184.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  24646. },
  24647. "port_directions": {
  24648. "C": "input",
  24649. "D": "input",
  24650. "E": "input",
  24651. "Q": "output"
  24652. },
  24653. "connections": {
  24654. "C": [ 42 ],
  24655. "D": [ 738 ],
  24656. "E": [ 733 ],
  24657. "Q": [ 741 ]
  24658. }
  24659. },
  24660. "cache_bus_I.ctrl_is_io_SB_DFFESR_Q": {
  24661. "hide_name": 0,
  24662. "type": "SB_DFFESR",
  24663. "parameters": {
  24664. },
  24665. "attributes": {
  24666. "module_not_derived": "00000000000000000000000000000001",
  24667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:175.2-184.5|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  24668. },
  24669. "port_directions": {
  24670. "C": "input",
  24671. "D": "input",
  24672. "E": "input",
  24673. "Q": "output",
  24674. "R": "input"
  24675. },
  24676. "connections": {
  24677. "C": [ 42 ],
  24678. "D": [ 735 ],
  24679. "E": [ 733 ],
  24680. "Q": [ 742 ],
  24681. "R": [ 738 ]
  24682. }
  24683. },
  24684. "cache_bus_I.ctrl_is_ram_SB_DFFE_Q": {
  24685. "hide_name": 0,
  24686. "type": "SB_DFFE",
  24687. "parameters": {
  24688. },
  24689. "attributes": {
  24690. "module_not_derived": "00000000000000000000000000000001",
  24691. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:175.2-184.5|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  24692. },
  24693. "port_directions": {
  24694. "C": "input",
  24695. "D": "input",
  24696. "E": "input",
  24697. "Q": "output"
  24698. },
  24699. "connections": {
  24700. "C": [ 42 ],
  24701. "D": [ 743 ],
  24702. "E": [ 733 ],
  24703. "Q": [ 744 ]
  24704. }
  24705. },
  24706. "cache_bus_I.ctrl_is_ram_SB_DFFE_Q_D_SB_LUT4_O": {
  24707. "hide_name": 0,
  24708. "type": "SB_LUT4",
  24709. "parameters": {
  24710. "LUT_INIT": "0000111100010001"
  24711. },
  24712. "attributes": {
  24713. "module_not_derived": "00000000000000000000000000000001",
  24714. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  24715. },
  24716. "port_directions": {
  24717. "I0": "input",
  24718. "I1": "input",
  24719. "I2": "input",
  24720. "I3": "input",
  24721. "O": "output"
  24722. },
  24723. "connections": {
  24724. "I0": [ 735 ],
  24725. "I1": [ 736 ],
  24726. "I2": [ 737 ],
  24727. "I3": [ 738 ],
  24728. "O": [ 743 ]
  24729. }
  24730. },
  24731. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O": {
  24732. "hide_name": 0,
  24733. "type": "SB_LUT4",
  24734. "parameters": {
  24735. "LUT_INIT": "1111001111000000"
  24736. },
  24737. "attributes": {
  24738. "module_not_derived": "00000000000000000000000000000001",
  24739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24740. },
  24741. "port_directions": {
  24742. "I0": "input",
  24743. "I1": "input",
  24744. "I2": "input",
  24745. "I3": "input",
  24746. "O": "output"
  24747. },
  24748. "connections": {
  24749. "I0": [ "0" ],
  24750. "I1": [ 742 ],
  24751. "I2": [ 745 ],
  24752. "I3": [ 746 ],
  24753. "O": [ 747 ]
  24754. }
  24755. },
  24756. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_1": {
  24757. "hide_name": 0,
  24758. "type": "SB_LUT4",
  24759. "parameters": {
  24760. "LUT_INIT": "1111001111000000"
  24761. },
  24762. "attributes": {
  24763. "module_not_derived": "00000000000000000000000000000001",
  24764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24765. },
  24766. "port_directions": {
  24767. "I0": "input",
  24768. "I1": "input",
  24769. "I2": "input",
  24770. "I3": "input",
  24771. "O": "output"
  24772. },
  24773. "connections": {
  24774. "I0": [ "0" ],
  24775. "I1": [ 742 ],
  24776. "I2": [ 748 ],
  24777. "I3": [ 749 ],
  24778. "O": [ 750 ]
  24779. }
  24780. },
  24781. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_10": {
  24782. "hide_name": 0,
  24783. "type": "SB_LUT4",
  24784. "parameters": {
  24785. "LUT_INIT": "1111001111000000"
  24786. },
  24787. "attributes": {
  24788. "module_not_derived": "00000000000000000000000000000001",
  24789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24790. },
  24791. "port_directions": {
  24792. "I0": "input",
  24793. "I1": "input",
  24794. "I2": "input",
  24795. "I3": "input",
  24796. "O": "output"
  24797. },
  24798. "connections": {
  24799. "I0": [ "0" ],
  24800. "I1": [ 742 ],
  24801. "I2": [ 751 ],
  24802. "I3": [ 752 ],
  24803. "O": [ 753 ]
  24804. }
  24805. },
  24806. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_11": {
  24807. "hide_name": 0,
  24808. "type": "SB_LUT4",
  24809. "parameters": {
  24810. "LUT_INIT": "1111001111000000"
  24811. },
  24812. "attributes": {
  24813. "module_not_derived": "00000000000000000000000000000001",
  24814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24815. },
  24816. "port_directions": {
  24817. "I0": "input",
  24818. "I1": "input",
  24819. "I2": "input",
  24820. "I3": "input",
  24821. "O": "output"
  24822. },
  24823. "connections": {
  24824. "I0": [ "0" ],
  24825. "I1": [ 742 ],
  24826. "I2": [ 754 ],
  24827. "I3": [ 755 ],
  24828. "O": [ 756 ]
  24829. }
  24830. },
  24831. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_12": {
  24832. "hide_name": 0,
  24833. "type": "SB_LUT4",
  24834. "parameters": {
  24835. "LUT_INIT": "1111001111000000"
  24836. },
  24837. "attributes": {
  24838. "module_not_derived": "00000000000000000000000000000001",
  24839. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24840. },
  24841. "port_directions": {
  24842. "I0": "input",
  24843. "I1": "input",
  24844. "I2": "input",
  24845. "I3": "input",
  24846. "O": "output"
  24847. },
  24848. "connections": {
  24849. "I0": [ "0" ],
  24850. "I1": [ 742 ],
  24851. "I2": [ 757 ],
  24852. "I3": [ 758 ],
  24853. "O": [ 759 ]
  24854. }
  24855. },
  24856. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_13": {
  24857. "hide_name": 0,
  24858. "type": "SB_LUT4",
  24859. "parameters": {
  24860. "LUT_INIT": "1111001111000000"
  24861. },
  24862. "attributes": {
  24863. "module_not_derived": "00000000000000000000000000000001",
  24864. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24865. },
  24866. "port_directions": {
  24867. "I0": "input",
  24868. "I1": "input",
  24869. "I2": "input",
  24870. "I3": "input",
  24871. "O": "output"
  24872. },
  24873. "connections": {
  24874. "I0": [ "0" ],
  24875. "I1": [ 742 ],
  24876. "I2": [ 760 ],
  24877. "I3": [ 761 ],
  24878. "O": [ 762 ]
  24879. }
  24880. },
  24881. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_14": {
  24882. "hide_name": 0,
  24883. "type": "SB_LUT4",
  24884. "parameters": {
  24885. "LUT_INIT": "1111001111000000"
  24886. },
  24887. "attributes": {
  24888. "module_not_derived": "00000000000000000000000000000001",
  24889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24890. },
  24891. "port_directions": {
  24892. "I0": "input",
  24893. "I1": "input",
  24894. "I2": "input",
  24895. "I3": "input",
  24896. "O": "output"
  24897. },
  24898. "connections": {
  24899. "I0": [ "0" ],
  24900. "I1": [ 742 ],
  24901. "I2": [ 763 ],
  24902. "I3": [ 764 ],
  24903. "O": [ 765 ]
  24904. }
  24905. },
  24906. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_15": {
  24907. "hide_name": 0,
  24908. "type": "SB_LUT4",
  24909. "parameters": {
  24910. "LUT_INIT": "1111001111000000"
  24911. },
  24912. "attributes": {
  24913. "module_not_derived": "00000000000000000000000000000001",
  24914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24915. },
  24916. "port_directions": {
  24917. "I0": "input",
  24918. "I1": "input",
  24919. "I2": "input",
  24920. "I3": "input",
  24921. "O": "output"
  24922. },
  24923. "connections": {
  24924. "I0": [ "0" ],
  24925. "I1": [ 742 ],
  24926. "I2": [ 766 ],
  24927. "I3": [ 767 ],
  24928. "O": [ 768 ]
  24929. }
  24930. },
  24931. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_16": {
  24932. "hide_name": 0,
  24933. "type": "SB_LUT4",
  24934. "parameters": {
  24935. "LUT_INIT": "1111001111000000"
  24936. },
  24937. "attributes": {
  24938. "module_not_derived": "00000000000000000000000000000001",
  24939. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24940. },
  24941. "port_directions": {
  24942. "I0": "input",
  24943. "I1": "input",
  24944. "I2": "input",
  24945. "I3": "input",
  24946. "O": "output"
  24947. },
  24948. "connections": {
  24949. "I0": [ "0" ],
  24950. "I1": [ 742 ],
  24951. "I2": [ 769 ],
  24952. "I3": [ 770 ],
  24953. "O": [ 771 ]
  24954. }
  24955. },
  24956. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_17": {
  24957. "hide_name": 0,
  24958. "type": "SB_LUT4",
  24959. "parameters": {
  24960. "LUT_INIT": "1111001111000000"
  24961. },
  24962. "attributes": {
  24963. "module_not_derived": "00000000000000000000000000000001",
  24964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24965. },
  24966. "port_directions": {
  24967. "I0": "input",
  24968. "I1": "input",
  24969. "I2": "input",
  24970. "I3": "input",
  24971. "O": "output"
  24972. },
  24973. "connections": {
  24974. "I0": [ "0" ],
  24975. "I1": [ 742 ],
  24976. "I2": [ 772 ],
  24977. "I3": [ 773 ],
  24978. "O": [ 774 ]
  24979. }
  24980. },
  24981. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_18": {
  24982. "hide_name": 0,
  24983. "type": "SB_LUT4",
  24984. "parameters": {
  24985. "LUT_INIT": "1111001111000000"
  24986. },
  24987. "attributes": {
  24988. "module_not_derived": "00000000000000000000000000000001",
  24989. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  24990. },
  24991. "port_directions": {
  24992. "I0": "input",
  24993. "I1": "input",
  24994. "I2": "input",
  24995. "I3": "input",
  24996. "O": "output"
  24997. },
  24998. "connections": {
  24999. "I0": [ "0" ],
  25000. "I1": [ 742 ],
  25001. "I2": [ 775 ],
  25002. "I3": [ 776 ],
  25003. "O": [ 777 ]
  25004. }
  25005. },
  25006. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_19": {
  25007. "hide_name": 0,
  25008. "type": "SB_LUT4",
  25009. "parameters": {
  25010. "LUT_INIT": "1111001111000000"
  25011. },
  25012. "attributes": {
  25013. "module_not_derived": "00000000000000000000000000000001",
  25014. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25015. },
  25016. "port_directions": {
  25017. "I0": "input",
  25018. "I1": "input",
  25019. "I2": "input",
  25020. "I3": "input",
  25021. "O": "output"
  25022. },
  25023. "connections": {
  25024. "I0": [ "0" ],
  25025. "I1": [ 742 ],
  25026. "I2": [ 778 ],
  25027. "I3": [ 779 ],
  25028. "O": [ 780 ]
  25029. }
  25030. },
  25031. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_2": {
  25032. "hide_name": 0,
  25033. "type": "SB_LUT4",
  25034. "parameters": {
  25035. "LUT_INIT": "1111001111000000"
  25036. },
  25037. "attributes": {
  25038. "module_not_derived": "00000000000000000000000000000001",
  25039. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25040. },
  25041. "port_directions": {
  25042. "I0": "input",
  25043. "I1": "input",
  25044. "I2": "input",
  25045. "I3": "input",
  25046. "O": "output"
  25047. },
  25048. "connections": {
  25049. "I0": [ "0" ],
  25050. "I1": [ 742 ],
  25051. "I2": [ 781 ],
  25052. "I3": [ 782 ],
  25053. "O": [ 783 ]
  25054. }
  25055. },
  25056. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_20": {
  25057. "hide_name": 0,
  25058. "type": "SB_LUT4",
  25059. "parameters": {
  25060. "LUT_INIT": "1111001111000000"
  25061. },
  25062. "attributes": {
  25063. "module_not_derived": "00000000000000000000000000000001",
  25064. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25065. },
  25066. "port_directions": {
  25067. "I0": "input",
  25068. "I1": "input",
  25069. "I2": "input",
  25070. "I3": "input",
  25071. "O": "output"
  25072. },
  25073. "connections": {
  25074. "I0": [ "0" ],
  25075. "I1": [ 742 ],
  25076. "I2": [ 784 ],
  25077. "I3": [ 785 ],
  25078. "O": [ 786 ]
  25079. }
  25080. },
  25081. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_21": {
  25082. "hide_name": 0,
  25083. "type": "SB_LUT4",
  25084. "parameters": {
  25085. "LUT_INIT": "1111001111000000"
  25086. },
  25087. "attributes": {
  25088. "module_not_derived": "00000000000000000000000000000001",
  25089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25090. },
  25091. "port_directions": {
  25092. "I0": "input",
  25093. "I1": "input",
  25094. "I2": "input",
  25095. "I3": "input",
  25096. "O": "output"
  25097. },
  25098. "connections": {
  25099. "I0": [ "0" ],
  25100. "I1": [ 742 ],
  25101. "I2": [ 787 ],
  25102. "I3": [ 788 ],
  25103. "O": [ 789 ]
  25104. }
  25105. },
  25106. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_22": {
  25107. "hide_name": 0,
  25108. "type": "SB_LUT4",
  25109. "parameters": {
  25110. "LUT_INIT": "1111001111000000"
  25111. },
  25112. "attributes": {
  25113. "module_not_derived": "00000000000000000000000000000001",
  25114. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25115. },
  25116. "port_directions": {
  25117. "I0": "input",
  25118. "I1": "input",
  25119. "I2": "input",
  25120. "I3": "input",
  25121. "O": "output"
  25122. },
  25123. "connections": {
  25124. "I0": [ "0" ],
  25125. "I1": [ 742 ],
  25126. "I2": [ 790 ],
  25127. "I3": [ 791 ],
  25128. "O": [ 792 ]
  25129. }
  25130. },
  25131. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_23": {
  25132. "hide_name": 0,
  25133. "type": "SB_LUT4",
  25134. "parameters": {
  25135. "LUT_INIT": "1111001111000000"
  25136. },
  25137. "attributes": {
  25138. "module_not_derived": "00000000000000000000000000000001",
  25139. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25140. },
  25141. "port_directions": {
  25142. "I0": "input",
  25143. "I1": "input",
  25144. "I2": "input",
  25145. "I3": "input",
  25146. "O": "output"
  25147. },
  25148. "connections": {
  25149. "I0": [ "0" ],
  25150. "I1": [ 742 ],
  25151. "I2": [ 793 ],
  25152. "I3": [ 794 ],
  25153. "O": [ 795 ]
  25154. }
  25155. },
  25156. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_24": {
  25157. "hide_name": 0,
  25158. "type": "SB_LUT4",
  25159. "parameters": {
  25160. "LUT_INIT": "1111001111000000"
  25161. },
  25162. "attributes": {
  25163. "module_not_derived": "00000000000000000000000000000001",
  25164. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25165. },
  25166. "port_directions": {
  25167. "I0": "input",
  25168. "I1": "input",
  25169. "I2": "input",
  25170. "I3": "input",
  25171. "O": "output"
  25172. },
  25173. "connections": {
  25174. "I0": [ "0" ],
  25175. "I1": [ 742 ],
  25176. "I2": [ 796 ],
  25177. "I3": [ 797 ],
  25178. "O": [ 798 ]
  25179. }
  25180. },
  25181. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_25": {
  25182. "hide_name": 0,
  25183. "type": "SB_LUT4",
  25184. "parameters": {
  25185. "LUT_INIT": "1111001111000000"
  25186. },
  25187. "attributes": {
  25188. "module_not_derived": "00000000000000000000000000000001",
  25189. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25190. },
  25191. "port_directions": {
  25192. "I0": "input",
  25193. "I1": "input",
  25194. "I2": "input",
  25195. "I3": "input",
  25196. "O": "output"
  25197. },
  25198. "connections": {
  25199. "I0": [ "0" ],
  25200. "I1": [ 742 ],
  25201. "I2": [ 799 ],
  25202. "I3": [ 800 ],
  25203. "O": [ 801 ]
  25204. }
  25205. },
  25206. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_26": {
  25207. "hide_name": 0,
  25208. "type": "SB_LUT4",
  25209. "parameters": {
  25210. "LUT_INIT": "1111001111000000"
  25211. },
  25212. "attributes": {
  25213. "module_not_derived": "00000000000000000000000000000001",
  25214. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25215. },
  25216. "port_directions": {
  25217. "I0": "input",
  25218. "I1": "input",
  25219. "I2": "input",
  25220. "I3": "input",
  25221. "O": "output"
  25222. },
  25223. "connections": {
  25224. "I0": [ "0" ],
  25225. "I1": [ 742 ],
  25226. "I2": [ 802 ],
  25227. "I3": [ 803 ],
  25228. "O": [ 804 ]
  25229. }
  25230. },
  25231. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_27": {
  25232. "hide_name": 0,
  25233. "type": "SB_LUT4",
  25234. "parameters": {
  25235. "LUT_INIT": "1111001111000000"
  25236. },
  25237. "attributes": {
  25238. "module_not_derived": "00000000000000000000000000000001",
  25239. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25240. },
  25241. "port_directions": {
  25242. "I0": "input",
  25243. "I1": "input",
  25244. "I2": "input",
  25245. "I3": "input",
  25246. "O": "output"
  25247. },
  25248. "connections": {
  25249. "I0": [ "0" ],
  25250. "I1": [ 742 ],
  25251. "I2": [ 805 ],
  25252. "I3": [ 806 ],
  25253. "O": [ 807 ]
  25254. }
  25255. },
  25256. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_28": {
  25257. "hide_name": 0,
  25258. "type": "SB_LUT4",
  25259. "parameters": {
  25260. "LUT_INIT": "1111001111000000"
  25261. },
  25262. "attributes": {
  25263. "module_not_derived": "00000000000000000000000000000001",
  25264. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25265. },
  25266. "port_directions": {
  25267. "I0": "input",
  25268. "I1": "input",
  25269. "I2": "input",
  25270. "I3": "input",
  25271. "O": "output"
  25272. },
  25273. "connections": {
  25274. "I0": [ "0" ],
  25275. "I1": [ 742 ],
  25276. "I2": [ 808 ],
  25277. "I3": [ 809 ],
  25278. "O": [ 810 ]
  25279. }
  25280. },
  25281. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_29": {
  25282. "hide_name": 0,
  25283. "type": "SB_LUT4",
  25284. "parameters": {
  25285. "LUT_INIT": "1111001111000000"
  25286. },
  25287. "attributes": {
  25288. "module_not_derived": "00000000000000000000000000000001",
  25289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25290. },
  25291. "port_directions": {
  25292. "I0": "input",
  25293. "I1": "input",
  25294. "I2": "input",
  25295. "I3": "input",
  25296. "O": "output"
  25297. },
  25298. "connections": {
  25299. "I0": [ "0" ],
  25300. "I1": [ 742 ],
  25301. "I2": [ 811 ],
  25302. "I3": [ 812 ],
  25303. "O": [ 813 ]
  25304. }
  25305. },
  25306. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_3": {
  25307. "hide_name": 0,
  25308. "type": "SB_LUT4",
  25309. "parameters": {
  25310. "LUT_INIT": "1111001111000000"
  25311. },
  25312. "attributes": {
  25313. "module_not_derived": "00000000000000000000000000000001",
  25314. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25315. },
  25316. "port_directions": {
  25317. "I0": "input",
  25318. "I1": "input",
  25319. "I2": "input",
  25320. "I3": "input",
  25321. "O": "output"
  25322. },
  25323. "connections": {
  25324. "I0": [ "0" ],
  25325. "I1": [ 742 ],
  25326. "I2": [ 814 ],
  25327. "I3": [ 815 ],
  25328. "O": [ 816 ]
  25329. }
  25330. },
  25331. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_30": {
  25332. "hide_name": 0,
  25333. "type": "SB_LUT4",
  25334. "parameters": {
  25335. "LUT_INIT": "1111001111000000"
  25336. },
  25337. "attributes": {
  25338. "module_not_derived": "00000000000000000000000000000001",
  25339. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25340. },
  25341. "port_directions": {
  25342. "I0": "input",
  25343. "I1": "input",
  25344. "I2": "input",
  25345. "I3": "input",
  25346. "O": "output"
  25347. },
  25348. "connections": {
  25349. "I0": [ "0" ],
  25350. "I1": [ 742 ],
  25351. "I2": [ 817 ],
  25352. "I3": [ 818 ],
  25353. "O": [ 819 ]
  25354. }
  25355. },
  25356. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_31": {
  25357. "hide_name": 0,
  25358. "type": "SB_LUT4",
  25359. "parameters": {
  25360. "LUT_INIT": "1111001111000000"
  25361. },
  25362. "attributes": {
  25363. "module_not_derived": "00000000000000000000000000000001",
  25364. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25365. },
  25366. "port_directions": {
  25367. "I0": "input",
  25368. "I1": "input",
  25369. "I2": "input",
  25370. "I3": "input",
  25371. "O": "output"
  25372. },
  25373. "connections": {
  25374. "I0": [ "0" ],
  25375. "I1": [ 742 ],
  25376. "I2": [ 820 ],
  25377. "I3": [ 821 ],
  25378. "O": [ 822 ]
  25379. }
  25380. },
  25381. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_4": {
  25382. "hide_name": 0,
  25383. "type": "SB_LUT4",
  25384. "parameters": {
  25385. "LUT_INIT": "1111001111000000"
  25386. },
  25387. "attributes": {
  25388. "module_not_derived": "00000000000000000000000000000001",
  25389. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25390. },
  25391. "port_directions": {
  25392. "I0": "input",
  25393. "I1": "input",
  25394. "I2": "input",
  25395. "I3": "input",
  25396. "O": "output"
  25397. },
  25398. "connections": {
  25399. "I0": [ "0" ],
  25400. "I1": [ 742 ],
  25401. "I2": [ 823 ],
  25402. "I3": [ 824 ],
  25403. "O": [ 825 ]
  25404. }
  25405. },
  25406. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_5": {
  25407. "hide_name": 0,
  25408. "type": "SB_LUT4",
  25409. "parameters": {
  25410. "LUT_INIT": "1111001111000000"
  25411. },
  25412. "attributes": {
  25413. "module_not_derived": "00000000000000000000000000000001",
  25414. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25415. },
  25416. "port_directions": {
  25417. "I0": "input",
  25418. "I1": "input",
  25419. "I2": "input",
  25420. "I3": "input",
  25421. "O": "output"
  25422. },
  25423. "connections": {
  25424. "I0": [ "0" ],
  25425. "I1": [ 742 ],
  25426. "I2": [ 826 ],
  25427. "I3": [ 827 ],
  25428. "O": [ 828 ]
  25429. }
  25430. },
  25431. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_6": {
  25432. "hide_name": 0,
  25433. "type": "SB_LUT4",
  25434. "parameters": {
  25435. "LUT_INIT": "1111001111000000"
  25436. },
  25437. "attributes": {
  25438. "module_not_derived": "00000000000000000000000000000001",
  25439. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25440. },
  25441. "port_directions": {
  25442. "I0": "input",
  25443. "I1": "input",
  25444. "I2": "input",
  25445. "I3": "input",
  25446. "O": "output"
  25447. },
  25448. "connections": {
  25449. "I0": [ "0" ],
  25450. "I1": [ 742 ],
  25451. "I2": [ 829 ],
  25452. "I3": [ 830 ],
  25453. "O": [ 831 ]
  25454. }
  25455. },
  25456. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_7": {
  25457. "hide_name": 0,
  25458. "type": "SB_LUT4",
  25459. "parameters": {
  25460. "LUT_INIT": "1111001111000000"
  25461. },
  25462. "attributes": {
  25463. "module_not_derived": "00000000000000000000000000000001",
  25464. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25465. },
  25466. "port_directions": {
  25467. "I0": "input",
  25468. "I1": "input",
  25469. "I2": "input",
  25470. "I3": "input",
  25471. "O": "output"
  25472. },
  25473. "connections": {
  25474. "I0": [ "0" ],
  25475. "I1": [ 742 ],
  25476. "I2": [ 832 ],
  25477. "I3": [ 833 ],
  25478. "O": [ 834 ]
  25479. }
  25480. },
  25481. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_8": {
  25482. "hide_name": 0,
  25483. "type": "SB_LUT4",
  25484. "parameters": {
  25485. "LUT_INIT": "1111001111000000"
  25486. },
  25487. "attributes": {
  25488. "module_not_derived": "00000000000000000000000000000001",
  25489. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25490. },
  25491. "port_directions": {
  25492. "I0": "input",
  25493. "I1": "input",
  25494. "I2": "input",
  25495. "I3": "input",
  25496. "O": "output"
  25497. },
  25498. "connections": {
  25499. "I0": [ "0" ],
  25500. "I1": [ 742 ],
  25501. "I2": [ 835 ],
  25502. "I3": [ 836 ],
  25503. "O": [ 837 ]
  25504. }
  25505. },
  25506. "cache_bus_I.d_wb_dat_miso_SB_LUT4_O_9": {
  25507. "hide_name": 0,
  25508. "type": "SB_LUT4",
  25509. "parameters": {
  25510. "LUT_INIT": "1111001111000000"
  25511. },
  25512. "attributes": {
  25513. "module_not_derived": "00000000000000000000000000000001",
  25514. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25515. },
  25516. "port_directions": {
  25517. "I0": "input",
  25518. "I1": "input",
  25519. "I2": "input",
  25520. "I3": "input",
  25521. "O": "output"
  25522. },
  25523. "connections": {
  25524. "I0": [ "0" ],
  25525. "I1": [ 742 ],
  25526. "I2": [ 838 ],
  25527. "I3": [ 839 ],
  25528. "O": [ 840 ]
  25529. }
  25530. },
  25531. "cache_bus_I.i_axi_ar_valid_SB_LUT4_O": {
  25532. "hide_name": 0,
  25533. "type": "SB_LUT4",
  25534. "parameters": {
  25535. "LUT_INIT": "0000111100000000"
  25536. },
  25537. "attributes": {
  25538. "module_not_derived": "00000000000000000000000000000001",
  25539. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  25540. },
  25541. "port_directions": {
  25542. "I0": "input",
  25543. "I1": "input",
  25544. "I2": "input",
  25545. "I3": "input",
  25546. "O": "output"
  25547. },
  25548. "connections": {
  25549. "I0": [ "0" ],
  25550. "I1": [ "0" ],
  25551. "I2": [ 841 ],
  25552. "I3": [ 842 ],
  25553. "O": [ 738 ]
  25554. }
  25555. },
  25556. "cache_bus_I.i_axi_r_valid_SB_DFF_D": {
  25557. "hide_name": 0,
  25558. "type": "SB_DFF",
  25559. "parameters": {
  25560. },
  25561. "attributes": {
  25562. "module_not_derived": "00000000000000000000000000000001",
  25563. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25564. },
  25565. "port_directions": {
  25566. "C": "input",
  25567. "D": "input",
  25568. "Q": "output"
  25569. },
  25570. "connections": {
  25571. "C": [ 42 ],
  25572. "D": [ 843 ],
  25573. "Q": [ 844 ]
  25574. }
  25575. },
  25576. "cache_bus_I.i_axi_r_valid_SB_LUT4_O": {
  25577. "hide_name": 0,
  25578. "type": "SB_LUT4",
  25579. "parameters": {
  25580. "LUT_INIT": "1110101000101010"
  25581. },
  25582. "attributes": {
  25583. "module_not_derived": "00000000000000000000000000000001",
  25584. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  25585. },
  25586. "port_directions": {
  25587. "I0": "input",
  25588. "I1": "input",
  25589. "I2": "input",
  25590. "I3": "input",
  25591. "O": "output"
  25592. },
  25593. "connections": {
  25594. "I0": [ 845 ],
  25595. "I1": [ 741 ],
  25596. "I2": [ 734 ],
  25597. "I3": [ 638 ],
  25598. "O": [ 843 ]
  25599. }
  25600. },
  25601. "cache_bus_I.ib_addr_cnt_SB_DFF_Q": {
  25602. "hide_name": 0,
  25603. "type": "SB_DFF",
  25604. "parameters": {
  25605. },
  25606. "attributes": {
  25607. "module_not_derived": "00000000000000000000000000000001",
  25608. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:221.2-222.30|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25609. },
  25610. "port_directions": {
  25611. "C": "input",
  25612. "D": "input",
  25613. "Q": "output"
  25614. },
  25615. "connections": {
  25616. "C": [ 42 ],
  25617. "D": [ 703 ],
  25618. "Q": [ 846 ]
  25619. }
  25620. },
  25621. "cache_bus_I.ib_addr_cnt_SB_DFF_Q_1": {
  25622. "hide_name": 0,
  25623. "type": "SB_DFF",
  25624. "parameters": {
  25625. },
  25626. "attributes": {
  25627. "module_not_derived": "00000000000000000000000000000001",
  25628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:221.2-222.30|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25629. },
  25630. "port_directions": {
  25631. "C": "input",
  25632. "D": "input",
  25633. "Q": "output"
  25634. },
  25635. "connections": {
  25636. "C": [ 42 ],
  25637. "D": [ 705 ],
  25638. "Q": [ 847 ]
  25639. }
  25640. },
  25641. "cache_bus_I.ib_addr_cnt_SB_DFF_Q_2": {
  25642. "hide_name": 0,
  25643. "type": "SB_DFF",
  25644. "parameters": {
  25645. },
  25646. "attributes": {
  25647. "module_not_derived": "00000000000000000000000000000001",
  25648. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:221.2-222.30|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25649. },
  25650. "port_directions": {
  25651. "C": "input",
  25652. "D": "input",
  25653. "Q": "output"
  25654. },
  25655. "connections": {
  25656. "C": [ 42 ],
  25657. "D": [ 707 ],
  25658. "Q": [ 848 ]
  25659. }
  25660. },
  25661. "cache_bus_I.ib_addr_cnt_SB_LUT4_I1": {
  25662. "hide_name": 0,
  25663. "type": "SB_LUT4",
  25664. "parameters": {
  25665. "LUT_INIT": "1100000000000000"
  25666. },
  25667. "attributes": {
  25668. "module_not_derived": "00000000000000000000000000000001",
  25669. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  25670. },
  25671. "port_directions": {
  25672. "I0": "input",
  25673. "I1": "input",
  25674. "I2": "input",
  25675. "I3": "input",
  25676. "O": "output"
  25677. },
  25678. "connections": {
  25679. "I0": [ "0" ],
  25680. "I1": [ 846 ],
  25681. "I2": [ 847 ],
  25682. "I3": [ 848 ],
  25683. "O": [ 849 ]
  25684. }
  25685. },
  25686. "cache_bus_I.ib_addr_lsb_SB_LUT4_O": {
  25687. "hide_name": 0,
  25688. "type": "SB_LUT4",
  25689. "parameters": {
  25690. "LUT_INIT": "0001000101000100"
  25691. },
  25692. "attributes": {
  25693. "module_not_derived": "00000000000000000000000000000001",
  25694. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  25695. },
  25696. "port_directions": {
  25697. "I0": "input",
  25698. "I1": "input",
  25699. "I2": "input",
  25700. "I3": "input",
  25701. "O": "output"
  25702. },
  25703. "connections": {
  25704. "I0": [ 733 ],
  25705. "I1": [ 846 ],
  25706. "I2": [ "0" ],
  25707. "I3": [ 850 ],
  25708. "O": [ 703 ]
  25709. }
  25710. },
  25711. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_1": {
  25712. "hide_name": 0,
  25713. "type": "SB_LUT4",
  25714. "parameters": {
  25715. "LUT_INIT": "0001010000010100"
  25716. },
  25717. "attributes": {
  25718. "module_not_derived": "00000000000000000000000000000001",
  25719. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  25720. },
  25721. "port_directions": {
  25722. "I0": "input",
  25723. "I1": "input",
  25724. "I2": "input",
  25725. "I3": "input",
  25726. "O": "output"
  25727. },
  25728. "connections": {
  25729. "I0": [ 733 ],
  25730. "I1": [ 848 ],
  25731. "I2": [ 851 ],
  25732. "I3": [ "0" ],
  25733. "O": [ 707 ]
  25734. }
  25735. },
  25736. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_1_I2_SB_LUT4_O": {
  25737. "hide_name": 0,
  25738. "type": "SB_LUT4",
  25739. "parameters": {
  25740. "LUT_INIT": "1111111100100000"
  25741. },
  25742. "attributes": {
  25743. "module_not_derived": "00000000000000000000000000000001",
  25744. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  25745. },
  25746. "port_directions": {
  25747. "I0": "input",
  25748. "I1": "input",
  25749. "I2": "input",
  25750. "I3": "input",
  25751. "O": "output"
  25752. },
  25753. "connections": {
  25754. "I0": [ 852 ],
  25755. "I1": [ 853 ],
  25756. "I2": [ 854 ],
  25757. "I3": [ 638 ],
  25758. "O": [ 851 ]
  25759. }
  25760. },
  25761. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_2": {
  25762. "hide_name": 0,
  25763. "type": "SB_LUT4",
  25764. "parameters": {
  25765. "LUT_INIT": "0001000101000100"
  25766. },
  25767. "attributes": {
  25768. "module_not_derived": "00000000000000000000000000000001",
  25769. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  25770. },
  25771. "port_directions": {
  25772. "I0": "input",
  25773. "I1": "input",
  25774. "I2": "input",
  25775. "I3": "input",
  25776. "O": "output"
  25777. },
  25778. "connections": {
  25779. "I0": [ 733 ],
  25780. "I1": [ 847 ],
  25781. "I2": [ "0" ],
  25782. "I3": [ 855 ],
  25783. "O": [ 705 ]
  25784. }
  25785. },
  25786. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  25787. "hide_name": 0,
  25788. "type": "SB_CARRY",
  25789. "parameters": {
  25790. },
  25791. "attributes": {
  25792. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  25793. },
  25794. "port_directions": {
  25795. "CI": "input",
  25796. "CO": "output",
  25797. "I0": "input",
  25798. "I1": "input"
  25799. },
  25800. "connections": {
  25801. "CI": [ "0" ],
  25802. "CO": [ 855 ],
  25803. "I0": [ 848 ],
  25804. "I1": [ 851 ]
  25805. }
  25806. },
  25807. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_I3_SB_CARRY_CO": {
  25808. "hide_name": 0,
  25809. "type": "SB_CARRY",
  25810. "parameters": {
  25811. },
  25812. "attributes": {
  25813. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  25814. },
  25815. "port_directions": {
  25816. "CI": "input",
  25817. "CO": "output",
  25818. "I0": "input",
  25819. "I1": "input"
  25820. },
  25821. "connections": {
  25822. "CI": [ 855 ],
  25823. "CO": [ 850 ],
  25824. "I0": [ 847 ],
  25825. "I1": [ "0" ]
  25826. }
  25827. },
  25828. "cache_bus_I.rdata_io_SB_DFF_Q": {
  25829. "hide_name": 0,
  25830. "type": "SB_DFF",
  25831. "parameters": {
  25832. },
  25833. "attributes": {
  25834. "module_not_derived": "00000000000000000000000000000001",
  25835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25836. },
  25837. "port_directions": {
  25838. "C": "input",
  25839. "D": "input",
  25840. "Q": "output"
  25841. },
  25842. "connections": {
  25843. "C": [ 42 ],
  25844. "D": [ 856 ],
  25845. "Q": [ 832 ]
  25846. }
  25847. },
  25848. "cache_bus_I.rdata_io_SB_DFF_Q_1": {
  25849. "hide_name": 0,
  25850. "type": "SB_DFF",
  25851. "parameters": {
  25852. },
  25853. "attributes": {
  25854. "module_not_derived": "00000000000000000000000000000001",
  25855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25856. },
  25857. "port_directions": {
  25858. "C": "input",
  25859. "D": "input",
  25860. "Q": "output"
  25861. },
  25862. "connections": {
  25863. "C": [ 42 ],
  25864. "D": [ 857 ],
  25865. "Q": [ 835 ]
  25866. }
  25867. },
  25868. "cache_bus_I.rdata_io_SB_DFF_Q_10": {
  25869. "hide_name": 0,
  25870. "type": "SB_DFF",
  25871. "parameters": {
  25872. },
  25873. "attributes": {
  25874. "module_not_derived": "00000000000000000000000000000001",
  25875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25876. },
  25877. "port_directions": {
  25878. "C": "input",
  25879. "D": "input",
  25880. "Q": "output"
  25881. },
  25882. "connections": {
  25883. "C": [ 42 ],
  25884. "D": [ 858 ],
  25885. "Q": [ 775 ]
  25886. }
  25887. },
  25888. "cache_bus_I.rdata_io_SB_DFF_Q_11": {
  25889. "hide_name": 0,
  25890. "type": "SB_DFF",
  25891. "parameters": {
  25892. },
  25893. "attributes": {
  25894. "module_not_derived": "00000000000000000000000000000001",
  25895. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25896. },
  25897. "port_directions": {
  25898. "C": "input",
  25899. "D": "input",
  25900. "Q": "output"
  25901. },
  25902. "connections": {
  25903. "C": [ 42 ],
  25904. "D": [ 859 ],
  25905. "Q": [ 778 ]
  25906. }
  25907. },
  25908. "cache_bus_I.rdata_io_SB_DFF_Q_12": {
  25909. "hide_name": 0,
  25910. "type": "SB_DFF",
  25911. "parameters": {
  25912. },
  25913. "attributes": {
  25914. "module_not_derived": "00000000000000000000000000000001",
  25915. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25916. },
  25917. "port_directions": {
  25918. "C": "input",
  25919. "D": "input",
  25920. "Q": "output"
  25921. },
  25922. "connections": {
  25923. "C": [ 42 ],
  25924. "D": [ 860 ],
  25925. "Q": [ 787 ]
  25926. }
  25927. },
  25928. "cache_bus_I.rdata_io_SB_DFF_Q_13": {
  25929. "hide_name": 0,
  25930. "type": "SB_DFF",
  25931. "parameters": {
  25932. },
  25933. "attributes": {
  25934. "module_not_derived": "00000000000000000000000000000001",
  25935. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25936. },
  25937. "port_directions": {
  25938. "C": "input",
  25939. "D": "input",
  25940. "Q": "output"
  25941. },
  25942. "connections": {
  25943. "C": [ 42 ],
  25944. "D": [ 861 ],
  25945. "Q": [ 790 ]
  25946. }
  25947. },
  25948. "cache_bus_I.rdata_io_SB_DFF_Q_14": {
  25949. "hide_name": 0,
  25950. "type": "SB_DFF",
  25951. "parameters": {
  25952. },
  25953. "attributes": {
  25954. "module_not_derived": "00000000000000000000000000000001",
  25955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25956. },
  25957. "port_directions": {
  25958. "C": "input",
  25959. "D": "input",
  25960. "Q": "output"
  25961. },
  25962. "connections": {
  25963. "C": [ 42 ],
  25964. "D": [ 862 ],
  25965. "Q": [ 793 ]
  25966. }
  25967. },
  25968. "cache_bus_I.rdata_io_SB_DFF_Q_15": {
  25969. "hide_name": 0,
  25970. "type": "SB_DFF",
  25971. "parameters": {
  25972. },
  25973. "attributes": {
  25974. "module_not_derived": "00000000000000000000000000000001",
  25975. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25976. },
  25977. "port_directions": {
  25978. "C": "input",
  25979. "D": "input",
  25980. "Q": "output"
  25981. },
  25982. "connections": {
  25983. "C": [ 42 ],
  25984. "D": [ 863 ],
  25985. "Q": [ 796 ]
  25986. }
  25987. },
  25988. "cache_bus_I.rdata_io_SB_DFF_Q_16": {
  25989. "hide_name": 0,
  25990. "type": "SB_DFF",
  25991. "parameters": {
  25992. },
  25993. "attributes": {
  25994. "module_not_derived": "00000000000000000000000000000001",
  25995. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  25996. },
  25997. "port_directions": {
  25998. "C": "input",
  25999. "D": "input",
  26000. "Q": "output"
  26001. },
  26002. "connections": {
  26003. "C": [ 42 ],
  26004. "D": [ 864 ],
  26005. "Q": [ 799 ]
  26006. }
  26007. },
  26008. "cache_bus_I.rdata_io_SB_DFF_Q_17": {
  26009. "hide_name": 0,
  26010. "type": "SB_DFF",
  26011. "parameters": {
  26012. },
  26013. "attributes": {
  26014. "module_not_derived": "00000000000000000000000000000001",
  26015. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26016. },
  26017. "port_directions": {
  26018. "C": "input",
  26019. "D": "input",
  26020. "Q": "output"
  26021. },
  26022. "connections": {
  26023. "C": [ 42 ],
  26024. "D": [ 865 ],
  26025. "Q": [ 802 ]
  26026. }
  26027. },
  26028. "cache_bus_I.rdata_io_SB_DFF_Q_18": {
  26029. "hide_name": 0,
  26030. "type": "SB_DFF",
  26031. "parameters": {
  26032. },
  26033. "attributes": {
  26034. "module_not_derived": "00000000000000000000000000000001",
  26035. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26036. },
  26037. "port_directions": {
  26038. "C": "input",
  26039. "D": "input",
  26040. "Q": "output"
  26041. },
  26042. "connections": {
  26043. "C": [ 42 ],
  26044. "D": [ 866 ],
  26045. "Q": [ 805 ]
  26046. }
  26047. },
  26048. "cache_bus_I.rdata_io_SB_DFF_Q_19": {
  26049. "hide_name": 0,
  26050. "type": "SB_DFF",
  26051. "parameters": {
  26052. },
  26053. "attributes": {
  26054. "module_not_derived": "00000000000000000000000000000001",
  26055. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26056. },
  26057. "port_directions": {
  26058. "C": "input",
  26059. "D": "input",
  26060. "Q": "output"
  26061. },
  26062. "connections": {
  26063. "C": [ 42 ],
  26064. "D": [ 867 ],
  26065. "Q": [ 808 ]
  26066. }
  26067. },
  26068. "cache_bus_I.rdata_io_SB_DFF_Q_2": {
  26069. "hide_name": 0,
  26070. "type": "SB_DFF",
  26071. "parameters": {
  26072. },
  26073. "attributes": {
  26074. "module_not_derived": "00000000000000000000000000000001",
  26075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26076. },
  26077. "port_directions": {
  26078. "C": "input",
  26079. "D": "input",
  26080. "Q": "output"
  26081. },
  26082. "connections": {
  26083. "C": [ 42 ],
  26084. "D": [ 868 ],
  26085. "Q": [ 751 ]
  26086. }
  26087. },
  26088. "cache_bus_I.rdata_io_SB_DFF_Q_20": {
  26089. "hide_name": 0,
  26090. "type": "SB_DFF",
  26091. "parameters": {
  26092. },
  26093. "attributes": {
  26094. "module_not_derived": "00000000000000000000000000000001",
  26095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26096. },
  26097. "port_directions": {
  26098. "C": "input",
  26099. "D": "input",
  26100. "Q": "output"
  26101. },
  26102. "connections": {
  26103. "C": [ 42 ],
  26104. "D": [ 869 ],
  26105. "Q": [ 811 ]
  26106. }
  26107. },
  26108. "cache_bus_I.rdata_io_SB_DFF_Q_21": {
  26109. "hide_name": 0,
  26110. "type": "SB_DFF",
  26111. "parameters": {
  26112. },
  26113. "attributes": {
  26114. "module_not_derived": "00000000000000000000000000000001",
  26115. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26116. },
  26117. "port_directions": {
  26118. "C": "input",
  26119. "D": "input",
  26120. "Q": "output"
  26121. },
  26122. "connections": {
  26123. "C": [ 42 ],
  26124. "D": [ 870 ],
  26125. "Q": [ 817 ]
  26126. }
  26127. },
  26128. "cache_bus_I.rdata_io_SB_DFF_Q_22": {
  26129. "hide_name": 0,
  26130. "type": "SB_DFF",
  26131. "parameters": {
  26132. },
  26133. "attributes": {
  26134. "module_not_derived": "00000000000000000000000000000001",
  26135. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26136. },
  26137. "port_directions": {
  26138. "C": "input",
  26139. "D": "input",
  26140. "Q": "output"
  26141. },
  26142. "connections": {
  26143. "C": [ 42 ],
  26144. "D": [ 871 ],
  26145. "Q": [ 745 ]
  26146. }
  26147. },
  26148. "cache_bus_I.rdata_io_SB_DFF_Q_23": {
  26149. "hide_name": 0,
  26150. "type": "SB_DFF",
  26151. "parameters": {
  26152. },
  26153. "attributes": {
  26154. "module_not_derived": "00000000000000000000000000000001",
  26155. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26156. },
  26157. "port_directions": {
  26158. "C": "input",
  26159. "D": "input",
  26160. "Q": "output"
  26161. },
  26162. "connections": {
  26163. "C": [ 42 ],
  26164. "D": [ 872 ],
  26165. "Q": [ 748 ]
  26166. }
  26167. },
  26168. "cache_bus_I.rdata_io_SB_DFF_Q_24": {
  26169. "hide_name": 0,
  26170. "type": "SB_DFF",
  26171. "parameters": {
  26172. },
  26173. "attributes": {
  26174. "module_not_derived": "00000000000000000000000000000001",
  26175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26176. },
  26177. "port_directions": {
  26178. "C": "input",
  26179. "D": "input",
  26180. "Q": "output"
  26181. },
  26182. "connections": {
  26183. "C": [ 42 ],
  26184. "D": [ 873 ],
  26185. "Q": [ 781 ]
  26186. }
  26187. },
  26188. "cache_bus_I.rdata_io_SB_DFF_Q_25": {
  26189. "hide_name": 0,
  26190. "type": "SB_DFF",
  26191. "parameters": {
  26192. },
  26193. "attributes": {
  26194. "module_not_derived": "00000000000000000000000000000001",
  26195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26196. },
  26197. "port_directions": {
  26198. "C": "input",
  26199. "D": "input",
  26200. "Q": "output"
  26201. },
  26202. "connections": {
  26203. "C": [ 42 ],
  26204. "D": [ 874 ],
  26205. "Q": [ 814 ]
  26206. }
  26207. },
  26208. "cache_bus_I.rdata_io_SB_DFF_Q_26": {
  26209. "hide_name": 0,
  26210. "type": "SB_DFF",
  26211. "parameters": {
  26212. },
  26213. "attributes": {
  26214. "module_not_derived": "00000000000000000000000000000001",
  26215. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26216. },
  26217. "port_directions": {
  26218. "C": "input",
  26219. "D": "input",
  26220. "Q": "output"
  26221. },
  26222. "connections": {
  26223. "C": [ 42 ],
  26224. "D": [ 875 ],
  26225. "Q": [ 823 ]
  26226. }
  26227. },
  26228. "cache_bus_I.rdata_io_SB_DFF_Q_27": {
  26229. "hide_name": 0,
  26230. "type": "SB_DFF",
  26231. "parameters": {
  26232. },
  26233. "attributes": {
  26234. "module_not_derived": "00000000000000000000000000000001",
  26235. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26236. },
  26237. "port_directions": {
  26238. "C": "input",
  26239. "D": "input",
  26240. "Q": "output"
  26241. },
  26242. "connections": {
  26243. "C": [ 42 ],
  26244. "D": [ 876 ],
  26245. "Q": [ 826 ]
  26246. }
  26247. },
  26248. "cache_bus_I.rdata_io_SB_DFF_Q_28": {
  26249. "hide_name": 0,
  26250. "type": "SB_DFF",
  26251. "parameters": {
  26252. },
  26253. "attributes": {
  26254. "module_not_derived": "00000000000000000000000000000001",
  26255. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26256. },
  26257. "port_directions": {
  26258. "C": "input",
  26259. "D": "input",
  26260. "Q": "output"
  26261. },
  26262. "connections": {
  26263. "C": [ 42 ],
  26264. "D": [ 877 ],
  26265. "Q": [ 829 ]
  26266. }
  26267. },
  26268. "cache_bus_I.rdata_io_SB_DFF_Q_29": {
  26269. "hide_name": 0,
  26270. "type": "SB_DFF",
  26271. "parameters": {
  26272. },
  26273. "attributes": {
  26274. "module_not_derived": "00000000000000000000000000000001",
  26275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26276. },
  26277. "port_directions": {
  26278. "C": "input",
  26279. "D": "input",
  26280. "Q": "output"
  26281. },
  26282. "connections": {
  26283. "C": [ 42 ],
  26284. "D": [ 878 ],
  26285. "Q": [ 838 ]
  26286. }
  26287. },
  26288. "cache_bus_I.rdata_io_SB_DFF_Q_3": {
  26289. "hide_name": 0,
  26290. "type": "SB_DFF",
  26291. "parameters": {
  26292. },
  26293. "attributes": {
  26294. "module_not_derived": "00000000000000000000000000000001",
  26295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26296. },
  26297. "port_directions": {
  26298. "C": "input",
  26299. "D": "input",
  26300. "Q": "output"
  26301. },
  26302. "connections": {
  26303. "C": [ 42 ],
  26304. "D": [ 879 ],
  26305. "Q": [ 754 ]
  26306. }
  26307. },
  26308. "cache_bus_I.rdata_io_SB_DFF_Q_30": {
  26309. "hide_name": 0,
  26310. "type": "SB_DFF",
  26311. "parameters": {
  26312. },
  26313. "attributes": {
  26314. "module_not_derived": "00000000000000000000000000000001",
  26315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26316. },
  26317. "port_directions": {
  26318. "C": "input",
  26319. "D": "input",
  26320. "Q": "output"
  26321. },
  26322. "connections": {
  26323. "C": [ 42 ],
  26324. "D": [ 880 ],
  26325. "Q": [ 784 ]
  26326. }
  26327. },
  26328. "cache_bus_I.rdata_io_SB_DFF_Q_31": {
  26329. "hide_name": 0,
  26330. "type": "SB_DFF",
  26331. "parameters": {
  26332. },
  26333. "attributes": {
  26334. "module_not_derived": "00000000000000000000000000000001",
  26335. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26336. },
  26337. "port_directions": {
  26338. "C": "input",
  26339. "D": "input",
  26340. "Q": "output"
  26341. },
  26342. "connections": {
  26343. "C": [ 42 ],
  26344. "D": [ 881 ],
  26345. "Q": [ 820 ]
  26346. }
  26347. },
  26348. "cache_bus_I.rdata_io_SB_DFF_Q_4": {
  26349. "hide_name": 0,
  26350. "type": "SB_DFF",
  26351. "parameters": {
  26352. },
  26353. "attributes": {
  26354. "module_not_derived": "00000000000000000000000000000001",
  26355. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26356. },
  26357. "port_directions": {
  26358. "C": "input",
  26359. "D": "input",
  26360. "Q": "output"
  26361. },
  26362. "connections": {
  26363. "C": [ 42 ],
  26364. "D": [ 882 ],
  26365. "Q": [ 757 ]
  26366. }
  26367. },
  26368. "cache_bus_I.rdata_io_SB_DFF_Q_5": {
  26369. "hide_name": 0,
  26370. "type": "SB_DFF",
  26371. "parameters": {
  26372. },
  26373. "attributes": {
  26374. "module_not_derived": "00000000000000000000000000000001",
  26375. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26376. },
  26377. "port_directions": {
  26378. "C": "input",
  26379. "D": "input",
  26380. "Q": "output"
  26381. },
  26382. "connections": {
  26383. "C": [ 42 ],
  26384. "D": [ 883 ],
  26385. "Q": [ 760 ]
  26386. }
  26387. },
  26388. "cache_bus_I.rdata_io_SB_DFF_Q_6": {
  26389. "hide_name": 0,
  26390. "type": "SB_DFF",
  26391. "parameters": {
  26392. },
  26393. "attributes": {
  26394. "module_not_derived": "00000000000000000000000000000001",
  26395. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26396. },
  26397. "port_directions": {
  26398. "C": "input",
  26399. "D": "input",
  26400. "Q": "output"
  26401. },
  26402. "connections": {
  26403. "C": [ 42 ],
  26404. "D": [ 884 ],
  26405. "Q": [ 763 ]
  26406. }
  26407. },
  26408. "cache_bus_I.rdata_io_SB_DFF_Q_7": {
  26409. "hide_name": 0,
  26410. "type": "SB_DFF",
  26411. "parameters": {
  26412. },
  26413. "attributes": {
  26414. "module_not_derived": "00000000000000000000000000000001",
  26415. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26416. },
  26417. "port_directions": {
  26418. "C": "input",
  26419. "D": "input",
  26420. "Q": "output"
  26421. },
  26422. "connections": {
  26423. "C": [ 42 ],
  26424. "D": [ 885 ],
  26425. "Q": [ 766 ]
  26426. }
  26427. },
  26428. "cache_bus_I.rdata_io_SB_DFF_Q_8": {
  26429. "hide_name": 0,
  26430. "type": "SB_DFF",
  26431. "parameters": {
  26432. },
  26433. "attributes": {
  26434. "module_not_derived": "00000000000000000000000000000001",
  26435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26436. },
  26437. "port_directions": {
  26438. "C": "input",
  26439. "D": "input",
  26440. "Q": "output"
  26441. },
  26442. "connections": {
  26443. "C": [ 42 ],
  26444. "D": [ 886 ],
  26445. "Q": [ 769 ]
  26446. }
  26447. },
  26448. "cache_bus_I.rdata_io_SB_DFF_Q_9": {
  26449. "hide_name": 0,
  26450. "type": "SB_DFF",
  26451. "parameters": {
  26452. },
  26453. "attributes": {
  26454. "module_not_derived": "00000000000000000000000000000001",
  26455. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:198.2-204.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  26456. },
  26457. "port_directions": {
  26458. "C": "input",
  26459. "D": "input",
  26460. "Q": "output"
  26461. },
  26462. "connections": {
  26463. "C": [ 42 ],
  26464. "D": [ 887 ],
  26465. "Q": [ 772 ]
  26466. }
  26467. },
  26468. "cache_bus_I.rdata_mux_i_SB_LUT4_O": {
  26469. "hide_name": 0,
  26470. "type": "SB_LUT4",
  26471. "parameters": {
  26472. "LUT_INIT": "1100110011110000"
  26473. },
  26474. "attributes": {
  26475. "module_not_derived": "00000000000000000000000000000001",
  26476. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26477. },
  26478. "port_directions": {
  26479. "I0": "input",
  26480. "I1": "input",
  26481. "I2": "input",
  26482. "I3": "input",
  26483. "O": "output"
  26484. },
  26485. "connections": {
  26486. "I0": [ "0" ],
  26487. "I1": [ 51 ],
  26488. "I2": [ 181 ],
  26489. "I3": [ 744 ],
  26490. "O": [ 785 ]
  26491. }
  26492. },
  26493. "cache_bus_I.rdata_mux_i_SB_LUT4_O_1": {
  26494. "hide_name": 0,
  26495. "type": "SB_LUT4",
  26496. "parameters": {
  26497. "LUT_INIT": "1100110011110000"
  26498. },
  26499. "attributes": {
  26500. "module_not_derived": "00000000000000000000000000000001",
  26501. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26502. },
  26503. "port_directions": {
  26504. "I0": "input",
  26505. "I1": "input",
  26506. "I2": "input",
  26507. "I3": "input",
  26508. "O": "output"
  26509. },
  26510. "connections": {
  26511. "I0": [ "0" ],
  26512. "I1": [ 47 ],
  26513. "I2": [ 182 ],
  26514. "I3": [ 744 ],
  26515. "O": [ 839 ]
  26516. }
  26517. },
  26518. "cache_bus_I.rdata_mux_i_SB_LUT4_O_10": {
  26519. "hide_name": 0,
  26520. "type": "SB_LUT4",
  26521. "parameters": {
  26522. "LUT_INIT": "1111000011001100"
  26523. },
  26524. "attributes": {
  26525. "module_not_derived": "00000000000000000000000000000001",
  26526. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26527. },
  26528. "port_directions": {
  26529. "I0": "input",
  26530. "I1": "input",
  26531. "I2": "input",
  26532. "I3": "input",
  26533. "O": "output"
  26534. },
  26535. "connections": {
  26536. "I0": [ "0" ],
  26537. "I1": [ 187 ],
  26538. "I2": [ 56 ],
  26539. "I3": [ 744 ],
  26540. "O": [ 812 ]
  26541. }
  26542. },
  26543. "cache_bus_I.rdata_mux_i_SB_LUT4_O_11": {
  26544. "hide_name": 0,
  26545. "type": "SB_LUT4",
  26546. "parameters": {
  26547. "LUT_INIT": "1100110011110000"
  26548. },
  26549. "attributes": {
  26550. "module_not_derived": "00000000000000000000000000000001",
  26551. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26552. },
  26553. "port_directions": {
  26554. "I0": "input",
  26555. "I1": "input",
  26556. "I2": "input",
  26557. "I3": "input",
  26558. "O": "output"
  26559. },
  26560. "connections": {
  26561. "I0": [ "0" ],
  26562. "I1": [ 46 ],
  26563. "I2": [ 253 ],
  26564. "I3": [ 744 ],
  26565. "O": [ 809 ]
  26566. }
  26567. },
  26568. "cache_bus_I.rdata_mux_i_SB_LUT4_O_12": {
  26569. "hide_name": 0,
  26570. "type": "SB_LUT4",
  26571. "parameters": {
  26572. "LUT_INIT": "1111000011001100"
  26573. },
  26574. "attributes": {
  26575. "module_not_derived": "00000000000000000000000000000001",
  26576. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26577. },
  26578. "port_directions": {
  26579. "I0": "input",
  26580. "I1": "input",
  26581. "I2": "input",
  26582. "I3": "input",
  26583. "O": "output"
  26584. },
  26585. "connections": {
  26586. "I0": [ "0" ],
  26587. "I1": [ 254 ],
  26588. "I2": [ 54 ],
  26589. "I3": [ 744 ],
  26590. "O": [ 806 ]
  26591. }
  26592. },
  26593. "cache_bus_I.rdata_mux_i_SB_LUT4_O_13": {
  26594. "hide_name": 0,
  26595. "type": "SB_LUT4",
  26596. "parameters": {
  26597. "LUT_INIT": "1100110011110000"
  26598. },
  26599. "attributes": {
  26600. "module_not_derived": "00000000000000000000000000000001",
  26601. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26602. },
  26603. "port_directions": {
  26604. "I0": "input",
  26605. "I1": "input",
  26606. "I2": "input",
  26607. "I3": "input",
  26608. "O": "output"
  26609. },
  26610. "connections": {
  26611. "I0": [ "0" ],
  26612. "I1": [ 50 ],
  26613. "I2": [ 255 ],
  26614. "I3": [ 744 ],
  26615. "O": [ 803 ]
  26616. }
  26617. },
  26618. "cache_bus_I.rdata_mux_i_SB_LUT4_O_14": {
  26619. "hide_name": 0,
  26620. "type": "SB_LUT4",
  26621. "parameters": {
  26622. "LUT_INIT": "1111000011001100"
  26623. },
  26624. "attributes": {
  26625. "module_not_derived": "00000000000000000000000000000001",
  26626. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26627. },
  26628. "port_directions": {
  26629. "I0": "input",
  26630. "I1": "input",
  26631. "I2": "input",
  26632. "I3": "input",
  26633. "O": "output"
  26634. },
  26635. "connections": {
  26636. "I0": [ "0" ],
  26637. "I1": [ 256 ],
  26638. "I2": [ 58 ],
  26639. "I3": [ 744 ],
  26640. "O": [ 800 ]
  26641. }
  26642. },
  26643. "cache_bus_I.rdata_mux_i_SB_LUT4_O_15": {
  26644. "hide_name": 0,
  26645. "type": "SB_LUT4",
  26646. "parameters": {
  26647. "LUT_INIT": "1111000011001100"
  26648. },
  26649. "attributes": {
  26650. "module_not_derived": "00000000000000000000000000000001",
  26651. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26652. },
  26653. "port_directions": {
  26654. "I0": "input",
  26655. "I1": "input",
  26656. "I2": "input",
  26657. "I3": "input",
  26658. "O": "output"
  26659. },
  26660. "connections": {
  26661. "I0": [ "0" ],
  26662. "I1": [ 188 ],
  26663. "I2": [ 78 ],
  26664. "I3": [ 744 ],
  26665. "O": [ 797 ]
  26666. }
  26667. },
  26668. "cache_bus_I.rdata_mux_i_SB_LUT4_O_16": {
  26669. "hide_name": 0,
  26670. "type": "SB_LUT4",
  26671. "parameters": {
  26672. "LUT_INIT": "1100110011110000"
  26673. },
  26674. "attributes": {
  26675. "module_not_derived": "00000000000000000000000000000001",
  26676. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26677. },
  26678. "port_directions": {
  26679. "I0": "input",
  26680. "I1": "input",
  26681. "I2": "input",
  26682. "I3": "input",
  26683. "O": "output"
  26684. },
  26685. "connections": {
  26686. "I0": [ "0" ],
  26687. "I1": [ 86 ],
  26688. "I2": [ 189 ],
  26689. "I3": [ 744 ],
  26690. "O": [ 794 ]
  26691. }
  26692. },
  26693. "cache_bus_I.rdata_mux_i_SB_LUT4_O_17": {
  26694. "hide_name": 0,
  26695. "type": "SB_LUT4",
  26696. "parameters": {
  26697. "LUT_INIT": "1111000011001100"
  26698. },
  26699. "attributes": {
  26700. "module_not_derived": "00000000000000000000000000000001",
  26701. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26702. },
  26703. "port_directions": {
  26704. "I0": "input",
  26705. "I1": "input",
  26706. "I2": "input",
  26707. "I3": "input",
  26708. "O": "output"
  26709. },
  26710. "connections": {
  26711. "I0": [ "0" ],
  26712. "I1": [ 190 ],
  26713. "I2": [ 82 ],
  26714. "I3": [ 744 ],
  26715. "O": [ 791 ]
  26716. }
  26717. },
  26718. "cache_bus_I.rdata_mux_i_SB_LUT4_O_18": {
  26719. "hide_name": 0,
  26720. "type": "SB_LUT4",
  26721. "parameters": {
  26722. "LUT_INIT": "1100110011110000"
  26723. },
  26724. "attributes": {
  26725. "module_not_derived": "00000000000000000000000000000001",
  26726. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26727. },
  26728. "port_directions": {
  26729. "I0": "input",
  26730. "I1": "input",
  26731. "I2": "input",
  26732. "I3": "input",
  26733. "O": "output"
  26734. },
  26735. "connections": {
  26736. "I0": [ "0" ],
  26737. "I1": [ 90 ],
  26738. "I2": [ 191 ],
  26739. "I3": [ 744 ],
  26740. "O": [ 788 ]
  26741. }
  26742. },
  26743. "cache_bus_I.rdata_mux_i_SB_LUT4_O_19": {
  26744. "hide_name": 0,
  26745. "type": "SB_LUT4",
  26746. "parameters": {
  26747. "LUT_INIT": "1100110011110000"
  26748. },
  26749. "attributes": {
  26750. "module_not_derived": "00000000000000000000000000000001",
  26751. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26752. },
  26753. "port_directions": {
  26754. "I0": "input",
  26755. "I1": "input",
  26756. "I2": "input",
  26757. "I3": "input",
  26758. "O": "output"
  26759. },
  26760. "connections": {
  26761. "I0": [ "0" ],
  26762. "I1": [ 80 ],
  26763. "I2": [ 257 ],
  26764. "I3": [ 744 ],
  26765. "O": [ 779 ]
  26766. }
  26767. },
  26768. "cache_bus_I.rdata_mux_i_SB_LUT4_O_2": {
  26769. "hide_name": 0,
  26770. "type": "SB_LUT4",
  26771. "parameters": {
  26772. "LUT_INIT": "1111000011001100"
  26773. },
  26774. "attributes": {
  26775. "module_not_derived": "00000000000000000000000000000001",
  26776. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26777. },
  26778. "port_directions": {
  26779. "I0": "input",
  26780. "I1": "input",
  26781. "I2": "input",
  26782. "I3": "input",
  26783. "O": "output"
  26784. },
  26785. "connections": {
  26786. "I0": [ "0" ],
  26787. "I1": [ 183 ],
  26788. "I2": [ 55 ],
  26789. "I3": [ 744 ],
  26790. "O": [ 830 ]
  26791. }
  26792. },
  26793. "cache_bus_I.rdata_mux_i_SB_LUT4_O_20": {
  26794. "hide_name": 0,
  26795. "type": "SB_LUT4",
  26796. "parameters": {
  26797. "LUT_INIT": "1111000011001100"
  26798. },
  26799. "attributes": {
  26800. "module_not_derived": "00000000000000000000000000000001",
  26801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26802. },
  26803. "port_directions": {
  26804. "I0": "input",
  26805. "I1": "input",
  26806. "I2": "input",
  26807. "I3": "input",
  26808. "O": "output"
  26809. },
  26810. "connections": {
  26811. "I0": [ "0" ],
  26812. "I1": [ 258 ],
  26813. "I2": [ 88 ],
  26814. "I3": [ 744 ],
  26815. "O": [ 776 ]
  26816. }
  26817. },
  26818. "cache_bus_I.rdata_mux_i_SB_LUT4_O_21": {
  26819. "hide_name": 0,
  26820. "type": "SB_LUT4",
  26821. "parameters": {
  26822. "LUT_INIT": "1111000011001100"
  26823. },
  26824. "attributes": {
  26825. "module_not_derived": "00000000000000000000000000000001",
  26826. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26827. },
  26828. "port_directions": {
  26829. "I0": "input",
  26830. "I1": "input",
  26831. "I2": "input",
  26832. "I3": "input",
  26833. "O": "output"
  26834. },
  26835. "connections": {
  26836. "I0": [ "0" ],
  26837. "I1": [ 259 ],
  26838. "I2": [ 84 ],
  26839. "I3": [ 744 ],
  26840. "O": [ 773 ]
  26841. }
  26842. },
  26843. "cache_bus_I.rdata_mux_i_SB_LUT4_O_22": {
  26844. "hide_name": 0,
  26845. "type": "SB_LUT4",
  26846. "parameters": {
  26847. "LUT_INIT": "1100110011110000"
  26848. },
  26849. "attributes": {
  26850. "module_not_derived": "00000000000000000000000000000001",
  26851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26852. },
  26853. "port_directions": {
  26854. "I0": "input",
  26855. "I1": "input",
  26856. "I2": "input",
  26857. "I3": "input",
  26858. "O": "output"
  26859. },
  26860. "connections": {
  26861. "I0": [ "0" ],
  26862. "I1": [ 92 ],
  26863. "I2": [ 260 ],
  26864. "I3": [ 744 ],
  26865. "O": [ 770 ]
  26866. }
  26867. },
  26868. "cache_bus_I.rdata_mux_i_SB_LUT4_O_23": {
  26869. "hide_name": 0,
  26870. "type": "SB_LUT4",
  26871. "parameters": {
  26872. "LUT_INIT": "1111000011001100"
  26873. },
  26874. "attributes": {
  26875. "module_not_derived": "00000000000000000000000000000001",
  26876. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26877. },
  26878. "port_directions": {
  26879. "I0": "input",
  26880. "I1": "input",
  26881. "I2": "input",
  26882. "I3": "input",
  26883. "O": "output"
  26884. },
  26885. "connections": {
  26886. "I0": [ "0" ],
  26887. "I1": [ 192 ],
  26888. "I2": [ 79 ],
  26889. "I3": [ 744 ],
  26890. "O": [ 767 ]
  26891. }
  26892. },
  26893. "cache_bus_I.rdata_mux_i_SB_LUT4_O_24": {
  26894. "hide_name": 0,
  26895. "type": "SB_LUT4",
  26896. "parameters": {
  26897. "LUT_INIT": "1111000011001100"
  26898. },
  26899. "attributes": {
  26900. "module_not_derived": "00000000000000000000000000000001",
  26901. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26902. },
  26903. "port_directions": {
  26904. "I0": "input",
  26905. "I1": "input",
  26906. "I2": "input",
  26907. "I3": "input",
  26908. "O": "output"
  26909. },
  26910. "connections": {
  26911. "I0": [ "0" ],
  26912. "I1": [ 193 ],
  26913. "I2": [ 87 ],
  26914. "I3": [ 744 ],
  26915. "O": [ 764 ]
  26916. }
  26917. },
  26918. "cache_bus_I.rdata_mux_i_SB_LUT4_O_25": {
  26919. "hide_name": 0,
  26920. "type": "SB_LUT4",
  26921. "parameters": {
  26922. "LUT_INIT": "1100110011110000"
  26923. },
  26924. "attributes": {
  26925. "module_not_derived": "00000000000000000000000000000001",
  26926. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26927. },
  26928. "port_directions": {
  26929. "I0": "input",
  26930. "I1": "input",
  26931. "I2": "input",
  26932. "I3": "input",
  26933. "O": "output"
  26934. },
  26935. "connections": {
  26936. "I0": [ "0" ],
  26937. "I1": [ 83 ],
  26938. "I2": [ 194 ],
  26939. "I3": [ 744 ],
  26940. "O": [ 761 ]
  26941. }
  26942. },
  26943. "cache_bus_I.rdata_mux_i_SB_LUT4_O_26": {
  26944. "hide_name": 0,
  26945. "type": "SB_LUT4",
  26946. "parameters": {
  26947. "LUT_INIT": "1100110011110000"
  26948. },
  26949. "attributes": {
  26950. "module_not_derived": "00000000000000000000000000000001",
  26951. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26952. },
  26953. "port_directions": {
  26954. "I0": "input",
  26955. "I1": "input",
  26956. "I2": "input",
  26957. "I3": "input",
  26958. "O": "output"
  26959. },
  26960. "connections": {
  26961. "I0": [ "0" ],
  26962. "I1": [ 91 ],
  26963. "I2": [ 195 ],
  26964. "I3": [ 744 ],
  26965. "O": [ 758 ]
  26966. }
  26967. },
  26968. "cache_bus_I.rdata_mux_i_SB_LUT4_O_27": {
  26969. "hide_name": 0,
  26970. "type": "SB_LUT4",
  26971. "parameters": {
  26972. "LUT_INIT": "1100110011110000"
  26973. },
  26974. "attributes": {
  26975. "module_not_derived": "00000000000000000000000000000001",
  26976. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  26977. },
  26978. "port_directions": {
  26979. "I0": "input",
  26980. "I1": "input",
  26981. "I2": "input",
  26982. "I3": "input",
  26983. "O": "output"
  26984. },
  26985. "connections": {
  26986. "I0": [ "0" ],
  26987. "I1": [ 81 ],
  26988. "I2": [ 261 ],
  26989. "I3": [ 744 ],
  26990. "O": [ 755 ]
  26991. }
  26992. },
  26993. "cache_bus_I.rdata_mux_i_SB_LUT4_O_28": {
  26994. "hide_name": 0,
  26995. "type": "SB_LUT4",
  26996. "parameters": {
  26997. "LUT_INIT": "1111000011001100"
  26998. },
  26999. "attributes": {
  27000. "module_not_derived": "00000000000000000000000000000001",
  27001. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27002. },
  27003. "port_directions": {
  27004. "I0": "input",
  27005. "I1": "input",
  27006. "I2": "input",
  27007. "I3": "input",
  27008. "O": "output"
  27009. },
  27010. "connections": {
  27011. "I0": [ "0" ],
  27012. "I1": [ 262 ],
  27013. "I2": [ 89 ],
  27014. "I3": [ 744 ],
  27015. "O": [ 752 ]
  27016. }
  27017. },
  27018. "cache_bus_I.rdata_mux_i_SB_LUT4_O_29": {
  27019. "hide_name": 0,
  27020. "type": "SB_LUT4",
  27021. "parameters": {
  27022. "LUT_INIT": "1111000011001100"
  27023. },
  27024. "attributes": {
  27025. "module_not_derived": "00000000000000000000000000000001",
  27026. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27027. },
  27028. "port_directions": {
  27029. "I0": "input",
  27030. "I1": "input",
  27031. "I2": "input",
  27032. "I3": "input",
  27033. "O": "output"
  27034. },
  27035. "connections": {
  27036. "I0": [ "0" ],
  27037. "I1": [ 263 ],
  27038. "I2": [ 85 ],
  27039. "I3": [ 744 ],
  27040. "O": [ 836 ]
  27041. }
  27042. },
  27043. "cache_bus_I.rdata_mux_i_SB_LUT4_O_3": {
  27044. "hide_name": 0,
  27045. "type": "SB_LUT4",
  27046. "parameters": {
  27047. "LUT_INIT": "1111000011001100"
  27048. },
  27049. "attributes": {
  27050. "module_not_derived": "00000000000000000000000000000001",
  27051. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27052. },
  27053. "port_directions": {
  27054. "I0": "input",
  27055. "I1": "input",
  27056. "I2": "input",
  27057. "I3": "input",
  27058. "O": "output"
  27059. },
  27060. "connections": {
  27061. "I0": [ "0" ],
  27062. "I1": [ 249 ],
  27063. "I2": [ 45 ],
  27064. "I3": [ 744 ],
  27065. "O": [ 827 ]
  27066. }
  27067. },
  27068. "cache_bus_I.rdata_mux_i_SB_LUT4_O_30": {
  27069. "hide_name": 0,
  27070. "type": "SB_LUT4",
  27071. "parameters": {
  27072. "LUT_INIT": "1100110011110000"
  27073. },
  27074. "attributes": {
  27075. "module_not_derived": "00000000000000000000000000000001",
  27076. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27077. },
  27078. "port_directions": {
  27079. "I0": "input",
  27080. "I1": "input",
  27081. "I2": "input",
  27082. "I3": "input",
  27083. "O": "output"
  27084. },
  27085. "connections": {
  27086. "I0": [ "0" ],
  27087. "I1": [ 93 ],
  27088. "I2": [ 264 ],
  27089. "I3": [ 744 ],
  27090. "O": [ 833 ]
  27091. }
  27092. },
  27093. "cache_bus_I.rdata_mux_i_SB_LUT4_O_31": {
  27094. "hide_name": 0,
  27095. "type": "SB_LUT4",
  27096. "parameters": {
  27097. "LUT_INIT": "1100111111000000"
  27098. },
  27099. "attributes": {
  27100. "module_not_derived": "00000000000000000000000000000001",
  27101. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27102. },
  27103. "port_directions": {
  27104. "I0": "input",
  27105. "I1": "input",
  27106. "I2": "input",
  27107. "I3": "input",
  27108. "O": "output"
  27109. },
  27110. "connections": {
  27111. "I0": [ "0" ],
  27112. "I1": [ 43 ],
  27113. "I2": [ 744 ],
  27114. "I3": [ 180 ],
  27115. "O": [ 821 ]
  27116. }
  27117. },
  27118. "cache_bus_I.rdata_mux_i_SB_LUT4_O_4": {
  27119. "hide_name": 0,
  27120. "type": "SB_LUT4",
  27121. "parameters": {
  27122. "LUT_INIT": "1100110011110000"
  27123. },
  27124. "attributes": {
  27125. "module_not_derived": "00000000000000000000000000000001",
  27126. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27127. },
  27128. "port_directions": {
  27129. "I0": "input",
  27130. "I1": "input",
  27131. "I2": "input",
  27132. "I3": "input",
  27133. "O": "output"
  27134. },
  27135. "connections": {
  27136. "I0": [ "0" ],
  27137. "I1": [ 53 ],
  27138. "I2": [ 250 ],
  27139. "I3": [ 744 ],
  27140. "O": [ 824 ]
  27141. }
  27142. },
  27143. "cache_bus_I.rdata_mux_i_SB_LUT4_O_5": {
  27144. "hide_name": 0,
  27145. "type": "SB_LUT4",
  27146. "parameters": {
  27147. "LUT_INIT": "1100110011110000"
  27148. },
  27149. "attributes": {
  27150. "module_not_derived": "00000000000000000000000000000001",
  27151. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27152. },
  27153. "port_directions": {
  27154. "I0": "input",
  27155. "I1": "input",
  27156. "I2": "input",
  27157. "I3": "input",
  27158. "O": "output"
  27159. },
  27160. "connections": {
  27161. "I0": [ "0" ],
  27162. "I1": [ 49 ],
  27163. "I2": [ 251 ],
  27164. "I3": [ 744 ],
  27165. "O": [ 815 ]
  27166. }
  27167. },
  27168. "cache_bus_I.rdata_mux_i_SB_LUT4_O_6": {
  27169. "hide_name": 0,
  27170. "type": "SB_LUT4",
  27171. "parameters": {
  27172. "LUT_INIT": "1111000011001100"
  27173. },
  27174. "attributes": {
  27175. "module_not_derived": "00000000000000000000000000000001",
  27176. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27177. },
  27178. "port_directions": {
  27179. "I0": "input",
  27180. "I1": "input",
  27181. "I2": "input",
  27182. "I3": "input",
  27183. "O": "output"
  27184. },
  27185. "connections": {
  27186. "I0": [ "0" ],
  27187. "I1": [ 252 ],
  27188. "I2": [ 57 ],
  27189. "I3": [ 744 ],
  27190. "O": [ 782 ]
  27191. }
  27192. },
  27193. "cache_bus_I.rdata_mux_i_SB_LUT4_O_7": {
  27194. "hide_name": 0,
  27195. "type": "SB_LUT4",
  27196. "parameters": {
  27197. "LUT_INIT": "1111000011001100"
  27198. },
  27199. "attributes": {
  27200. "module_not_derived": "00000000000000000000000000000001",
  27201. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27202. },
  27203. "port_directions": {
  27204. "I0": "input",
  27205. "I1": "input",
  27206. "I2": "input",
  27207. "I3": "input",
  27208. "O": "output"
  27209. },
  27210. "connections": {
  27211. "I0": [ "0" ],
  27212. "I1": [ 184 ],
  27213. "I2": [ 44 ],
  27214. "I3": [ 744 ],
  27215. "O": [ 749 ]
  27216. }
  27217. },
  27218. "cache_bus_I.rdata_mux_i_SB_LUT4_O_8": {
  27219. "hide_name": 0,
  27220. "type": "SB_LUT4",
  27221. "parameters": {
  27222. "LUT_INIT": "1111000011001100"
  27223. },
  27224. "attributes": {
  27225. "module_not_derived": "00000000000000000000000000000001",
  27226. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27227. },
  27228. "port_directions": {
  27229. "I0": "input",
  27230. "I1": "input",
  27231. "I2": "input",
  27232. "I3": "input",
  27233. "O": "output"
  27234. },
  27235. "connections": {
  27236. "I0": [ "0" ],
  27237. "I1": [ 185 ],
  27238. "I2": [ 52 ],
  27239. "I3": [ 744 ],
  27240. "O": [ 746 ]
  27241. }
  27242. },
  27243. "cache_bus_I.rdata_mux_i_SB_LUT4_O_9": {
  27244. "hide_name": 0,
  27245. "type": "SB_LUT4",
  27246. "parameters": {
  27247. "LUT_INIT": "1111000011001100"
  27248. },
  27249. "attributes": {
  27250. "module_not_derived": "00000000000000000000000000000001",
  27251. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27252. },
  27253. "port_directions": {
  27254. "I0": "input",
  27255. "I1": "input",
  27256. "I2": "input",
  27257. "I3": "input",
  27258. "O": "output"
  27259. },
  27260. "connections": {
  27261. "I0": [ "0" ],
  27262. "I1": [ 186 ],
  27263. "I2": [ 48 ],
  27264. "I3": [ 744 ],
  27265. "O": [ 818 ]
  27266. }
  27267. },
  27268. "cache_bus_I.req_new_SB_DFF_Q": {
  27269. "hide_name": 0,
  27270. "type": "SB_DFF",
  27271. "parameters": {
  27272. },
  27273. "attributes": {
  27274. "module_not_derived": "00000000000000000000000000000001",
  27275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:268.2-269.93|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  27276. },
  27277. "port_directions": {
  27278. "C": "input",
  27279. "D": "input",
  27280. "Q": "output"
  27281. },
  27282. "connections": {
  27283. "C": [ 42 ],
  27284. "D": [ 888 ],
  27285. "Q": [ 889 ]
  27286. }
  27287. },
  27288. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O": {
  27289. "hide_name": 0,
  27290. "type": "SB_LUT4",
  27291. "parameters": {
  27292. "LUT_INIT": "0010000010000000"
  27293. },
  27294. "attributes": {
  27295. "module_not_derived": "00000000000000000000000000000001",
  27296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27297. },
  27298. "port_directions": {
  27299. "I0": "input",
  27300. "I1": "input",
  27301. "I2": "input",
  27302. "I3": "input",
  27303. "O": "output"
  27304. },
  27305. "connections": {
  27306. "I0": [ 733 ],
  27307. "I1": [ 890 ],
  27308. "I2": [ 891 ],
  27309. "I3": [ 892 ],
  27310. "O": [ 888 ]
  27311. }
  27312. },
  27313. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_I3": {
  27314. "hide_name": 0,
  27315. "type": "SB_LUT4",
  27316. "parameters": {
  27317. "LUT_INIT": "0000000000010000"
  27318. },
  27319. "attributes": {
  27320. "module_not_derived": "00000000000000000000000000000001",
  27321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27322. },
  27323. "port_directions": {
  27324. "I0": "input",
  27325. "I1": "input",
  27326. "I2": "input",
  27327. "I3": "input",
  27328. "O": "output"
  27329. },
  27330. "connections": {
  27331. "I0": [ 893 ],
  27332. "I1": [ 894 ],
  27333. "I2": [ 733 ],
  27334. "I3": [ 891 ],
  27335. "O": [ 895 ]
  27336. }
  27337. },
  27338. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O": {
  27339. "hide_name": 0,
  27340. "type": "SB_LUT4",
  27341. "parameters": {
  27342. "LUT_INIT": "0000000000100011"
  27343. },
  27344. "attributes": {
  27345. "module_not_derived": "00000000000000000000000000000001",
  27346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27347. },
  27348. "port_directions": {
  27349. "I0": "input",
  27350. "I1": "input",
  27351. "I2": "input",
  27352. "I3": "input",
  27353. "O": "output"
  27354. },
  27355. "connections": {
  27356. "I0": [ 896 ],
  27357. "I1": [ 897 ],
  27358. "I2": [ 898 ],
  27359. "I3": [ 899 ],
  27360. "O": [ 892 ]
  27361. }
  27362. },
  27363. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O_1": {
  27364. "hide_name": 0,
  27365. "type": "SB_LUT4",
  27366. "parameters": {
  27367. "LUT_INIT": "0000000000001100"
  27368. },
  27369. "attributes": {
  27370. "module_not_derived": "00000000000000000000000000000001",
  27371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27372. },
  27373. "port_directions": {
  27374. "I0": "input",
  27375. "I1": "input",
  27376. "I2": "input",
  27377. "I3": "input",
  27378. "O": "output"
  27379. },
  27380. "connections": {
  27381. "I0": [ "0" ],
  27382. "I1": [ 900 ],
  27383. "I2": [ 901 ],
  27384. "I3": [ 902 ],
  27385. "O": [ 890 ]
  27386. }
  27387. },
  27388. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O": {
  27389. "hide_name": 0,
  27390. "type": "SB_LUT4",
  27391. "parameters": {
  27392. "LUT_INIT": "0000000000000011"
  27393. },
  27394. "attributes": {
  27395. "module_not_derived": "00000000000000000000000000000001",
  27396. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27397. },
  27398. "port_directions": {
  27399. "I0": "input",
  27400. "I1": "input",
  27401. "I2": "input",
  27402. "I3": "input",
  27403. "O": "output"
  27404. },
  27405. "connections": {
  27406. "I0": [ "0" ],
  27407. "I1": [ 903 ],
  27408. "I2": [ 904 ],
  27409. "I3": [ 905 ],
  27410. "O": [ 891 ]
  27411. }
  27412. },
  27413. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_I3": {
  27414. "hide_name": 0,
  27415. "type": "SB_LUT4",
  27416. "parameters": {
  27417. "LUT_INIT": "1100111110001010"
  27418. },
  27419. "attributes": {
  27420. "module_not_derived": "00000000000000000000000000000001",
  27421. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27422. },
  27423. "port_directions": {
  27424. "I0": "input",
  27425. "I1": "input",
  27426. "I2": "input",
  27427. "I3": "input",
  27428. "O": "output"
  27429. },
  27430. "connections": {
  27431. "I0": [ 852 ],
  27432. "I1": [ 906 ],
  27433. "I2": [ 907 ],
  27434. "I3": [ 903 ],
  27435. "O": [ 901 ]
  27436. }
  27437. },
  27438. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_I3_I2_SB_LUT4_O": {
  27439. "hide_name": 0,
  27440. "type": "SB_LUT4",
  27441. "parameters": {
  27442. "LUT_INIT": "0011111100110011"
  27443. },
  27444. "attributes": {
  27445. "module_not_derived": "00000000000000000000000000000001",
  27446. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27447. },
  27448. "port_directions": {
  27449. "I0": "input",
  27450. "I1": "input",
  27451. "I2": "input",
  27452. "I3": "input",
  27453. "O": "output"
  27454. },
  27455. "connections": {
  27456. "I0": [ "0" ],
  27457. "I1": [ 845 ],
  27458. "I2": [ 734 ],
  27459. "I3": [ 849 ],
  27460. "O": [ 907 ]
  27461. }
  27462. },
  27463. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_I3_O_SB_LUT4_O": {
  27464. "hide_name": 0,
  27465. "type": "SB_LUT4",
  27466. "parameters": {
  27467. "LUT_INIT": "0001001101011111"
  27468. },
  27469. "attributes": {
  27470. "module_not_derived": "00000000000000000000000000000001",
  27471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27472. },
  27473. "port_directions": {
  27474. "I0": "input",
  27475. "I1": "input",
  27476. "I2": "input",
  27477. "I3": "input",
  27478. "O": "output"
  27479. },
  27480. "connections": {
  27481. "I0": [ 906 ],
  27482. "I1": [ 733 ],
  27483. "I2": [ 638 ],
  27484. "I3": [ 738 ],
  27485. "O": [ 900 ]
  27486. }
  27487. },
  27488. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_I3_O_SB_LUT4_O_1": {
  27489. "hide_name": 0,
  27490. "type": "SB_LUT4",
  27491. "parameters": {
  27492. "LUT_INIT": "0000100010101010"
  27493. },
  27494. "attributes": {
  27495. "module_not_derived": "00000000000000000000000000000001",
  27496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27497. },
  27498. "port_directions": {
  27499. "I0": "input",
  27500. "I1": "input",
  27501. "I2": "input",
  27502. "I3": "input",
  27503. "O": "output"
  27504. },
  27505. "connections": {
  27506. "I0": [ 852 ],
  27507. "I1": [ 733 ],
  27508. "I2": [ 740 ],
  27509. "I3": [ 908 ],
  27510. "O": [ 902 ]
  27511. }
  27512. },
  27513. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  27514. "hide_name": 0,
  27515. "type": "SB_LUT4",
  27516. "parameters": {
  27517. "LUT_INIT": "1100000000000000"
  27518. },
  27519. "attributes": {
  27520. "module_not_derived": "00000000000000000000000000000001",
  27521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27522. },
  27523. "port_directions": {
  27524. "I0": "input",
  27525. "I1": "input",
  27526. "I2": "input",
  27527. "I3": "input",
  27528. "O": "output"
  27529. },
  27530. "connections": {
  27531. "I0": [ "0" ],
  27532. "I1": [ 845 ],
  27533. "I2": [ 734 ],
  27534. "I3": [ 849 ],
  27535. "O": [ 903 ]
  27536. }
  27537. },
  27538. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  27539. "hide_name": 0,
  27540. "type": "SB_LUT4",
  27541. "parameters": {
  27542. "LUT_INIT": "0000110011001100"
  27543. },
  27544. "attributes": {
  27545. "module_not_derived": "00000000000000000000000000000001",
  27546. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27547. },
  27548. "port_directions": {
  27549. "I0": "input",
  27550. "I1": "input",
  27551. "I2": "input",
  27552. "I3": "input",
  27553. "O": "output"
  27554. },
  27555. "connections": {
  27556. "I0": [ "0" ],
  27557. "I1": [ 853 ],
  27558. "I2": [ 909 ],
  27559. "I3": [ 908 ],
  27560. "O": [ 905 ]
  27561. }
  27562. },
  27563. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  27564. "hide_name": 0,
  27565. "type": "SB_LUT4",
  27566. "parameters": {
  27567. "LUT_INIT": "1111001100000000"
  27568. },
  27569. "attributes": {
  27570. "module_not_derived": "00000000000000000000000000000001",
  27571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27572. },
  27573. "port_directions": {
  27574. "I0": "input",
  27575. "I1": "input",
  27576. "I2": "input",
  27577. "I3": "input",
  27578. "O": "output"
  27579. },
  27580. "connections": {
  27581. "I0": [ "0" ],
  27582. "I1": [ 906 ],
  27583. "I2": [ 638 ],
  27584. "I3": [ 907 ],
  27585. "O": [ 909 ]
  27586. }
  27587. },
  27588. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  27589. "hide_name": 0,
  27590. "type": "SB_LUT4",
  27591. "parameters": {
  27592. "LUT_INIT": "0011000100000000"
  27593. },
  27594. "attributes": {
  27595. "module_not_derived": "00000000000000000000000000000001",
  27596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27597. },
  27598. "port_directions": {
  27599. "I0": "input",
  27600. "I1": "input",
  27601. "I2": "input",
  27602. "I3": "input",
  27603. "O": "output"
  27604. },
  27605. "connections": {
  27606. "I0": [ 845 ],
  27607. "I1": [ 906 ],
  27608. "I2": [ 849 ],
  27609. "I3": [ 908 ],
  27610. "O": [ 910 ]
  27611. }
  27612. },
  27613. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I3": {
  27614. "hide_name": 0,
  27615. "type": "SB_LUT4",
  27616. "parameters": {
  27617. "LUT_INIT": "0000000011101100"
  27618. },
  27619. "attributes": {
  27620. "module_not_derived": "00000000000000000000000000000001",
  27621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27622. },
  27623. "port_directions": {
  27624. "I0": "input",
  27625. "I1": "input",
  27626. "I2": "input",
  27627. "I3": "input",
  27628. "O": "output"
  27629. },
  27630. "connections": {
  27631. "I0": [ 906 ],
  27632. "I1": [ 854 ],
  27633. "I2": [ 638 ],
  27634. "I3": [ 910 ],
  27635. "O": [ 899 ]
  27636. }
  27637. },
  27638. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O": {
  27639. "hide_name": 0,
  27640. "type": "SB_LUT4",
  27641. "parameters": {
  27642. "LUT_INIT": "0001000100001111"
  27643. },
  27644. "attributes": {
  27645. "module_not_derived": "00000000000000000000000000000001",
  27646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27647. },
  27648. "port_directions": {
  27649. "I0": "input",
  27650. "I1": "input",
  27651. "I2": "input",
  27652. "I3": "input",
  27653. "O": "output"
  27654. },
  27655. "connections": {
  27656. "I0": [ 735 ],
  27657. "I1": [ 736 ],
  27658. "I2": [ 854 ],
  27659. "I3": [ 740 ],
  27660. "O": [ 896 ]
  27661. }
  27662. },
  27663. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1": {
  27664. "hide_name": 0,
  27665. "type": "SB_LUT4",
  27666. "parameters": {
  27667. "LUT_INIT": "0011000000000000"
  27668. },
  27669. "attributes": {
  27670. "module_not_derived": "00000000000000000000000000000001",
  27671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27672. },
  27673. "port_directions": {
  27674. "I0": "input",
  27675. "I1": "input",
  27676. "I2": "input",
  27677. "I3": "input",
  27678. "O": "output"
  27679. },
  27680. "connections": {
  27681. "I0": [ "0" ],
  27682. "I1": [ 737 ],
  27683. "I2": [ 733 ],
  27684. "I3": [ 738 ],
  27685. "O": [ 897 ]
  27686. }
  27687. },
  27688. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  27689. "hide_name": 0,
  27690. "type": "SB_LUT4",
  27691. "parameters": {
  27692. "LUT_INIT": "0000100000001101"
  27693. },
  27694. "attributes": {
  27695. "module_not_derived": "00000000000000000000000000000001",
  27696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27697. },
  27698. "port_directions": {
  27699. "I0": "input",
  27700. "I1": "input",
  27701. "I2": "input",
  27702. "I3": "input",
  27703. "O": "output"
  27704. },
  27705. "connections": {
  27706. "I0": [ 470 ],
  27707. "I1": [ 638 ],
  27708. "I2": [ 911 ],
  27709. "I3": [ 912 ],
  27710. "O": [ 908 ]
  27711. }
  27712. },
  27713. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  27714. "hide_name": 0,
  27715. "type": "SB_LUT4",
  27716. "parameters": {
  27717. "LUT_INIT": "0000001100000000"
  27718. },
  27719. "attributes": {
  27720. "module_not_derived": "00000000000000000000000000000001",
  27721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27722. },
  27723. "port_directions": {
  27724. "I0": "input",
  27725. "I1": "input",
  27726. "I2": "input",
  27727. "I3": "input",
  27728. "O": "output"
  27729. },
  27730. "connections": {
  27731. "I0": [ "0" ],
  27732. "I1": [ 913 ],
  27733. "I2": [ 914 ],
  27734. "I3": [ 915 ],
  27735. "O": [ 912 ]
  27736. }
  27737. },
  27738. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  27739. "hide_name": 0,
  27740. "type": "SB_LUT4",
  27741. "parameters": {
  27742. "LUT_INIT": "0000000000000001"
  27743. },
  27744. "attributes": {
  27745. "module_not_derived": "00000000000000000000000000000001",
  27746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27747. },
  27748. "port_directions": {
  27749. "I0": "input",
  27750. "I1": "input",
  27751. "I2": "input",
  27752. "I3": "input",
  27753. "O": "output"
  27754. },
  27755. "connections": {
  27756. "I0": [ 916 ],
  27757. "I1": [ 845 ],
  27758. "I2": [ 906 ],
  27759. "I3": [ 733 ],
  27760. "O": [ 915 ]
  27761. }
  27762. },
  27763. "cache_bus_I.req_new_SB_LUT4_I1": {
  27764. "hide_name": 0,
  27765. "type": "SB_LUT4",
  27766. "parameters": {
  27767. "LUT_INIT": "0000000000010011"
  27768. },
  27769. "attributes": {
  27770. "module_not_derived": "00000000000000000000000000000001",
  27771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  27772. },
  27773. "port_directions": {
  27774. "I0": "input",
  27775. "I1": "input",
  27776. "I2": "input",
  27777. "I3": "input",
  27778. "O": "output"
  27779. },
  27780. "connections": {
  27781. "I0": [ 845 ],
  27782. "I1": [ 889 ],
  27783. "I2": [ 734 ],
  27784. "I3": [ 917 ],
  27785. "O": [ 135 ]
  27786. }
  27787. },
  27788. "cache_bus_I.req_new_SB_LUT4_I1_I3_SB_DFFR_Q": {
  27789. "hide_name": 0,
  27790. "type": "SB_DFFR",
  27791. "parameters": {
  27792. },
  27793. "attributes": {
  27794. "module_not_derived": "00000000000000000000000000000001",
  27795. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:503.2-510.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  27796. },
  27797. "port_directions": {
  27798. "C": "input",
  27799. "D": "input",
  27800. "Q": "output",
  27801. "R": "input"
  27802. },
  27803. "connections": {
  27804. "C": [ 42 ],
  27805. "D": [ 918 ],
  27806. "Q": [ 917 ],
  27807. "R": [ 127 ]
  27808. }
  27809. },
  27810. "cache_bus_I.req_new_SB_LUT4_I1_I3_SB_DFFR_Q_D_SB_LUT4_O": {
  27811. "hide_name": 0,
  27812. "type": "SB_LUT4",
  27813. "parameters": {
  27814. "LUT_INIT": "0000111100000000"
  27815. },
  27816. "attributes": {
  27817. "module_not_derived": "00000000000000000000000000000001",
  27818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  27819. },
  27820. "port_directions": {
  27821. "I0": "input",
  27822. "I1": "input",
  27823. "I2": "input",
  27824. "I3": "input",
  27825. "O": "output"
  27826. },
  27827. "connections": {
  27828. "I0": [ "0" ],
  27829. "I1": [ "0" ],
  27830. "I2": [ 135 ],
  27831. "I3": [ 232 ],
  27832. "O": [ 918 ]
  27833. }
  27834. },
  27835. "cache_bus_I.req_new_SB_LUT4_I1_O_SB_LUT4_O": {
  27836. "hide_name": 0,
  27837. "type": "SB_LUT4",
  27838. "parameters": {
  27839. "LUT_INIT": "1111001111110000"
  27840. },
  27841. "attributes": {
  27842. "module_not_derived": "00000000000000000000000000000001",
  27843. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27844. },
  27845. "port_directions": {
  27846. "I0": "input",
  27847. "I1": "input",
  27848. "I2": "input",
  27849. "I3": "input",
  27850. "O": "output"
  27851. },
  27852. "connections": {
  27853. "I0": [ "0" ],
  27854. "I1": [ 204 ],
  27855. "I2": [ 121 ],
  27856. "I3": [ 136 ],
  27857. "O": [ 232 ]
  27858. }
  27859. },
  27860. "cache_bus_I.req_new_SB_LUT4_I1_O_SB_LUT4_O_I3_SB_LUT4_O": {
  27861. "hide_name": 0,
  27862. "type": "SB_LUT4",
  27863. "parameters": {
  27864. "LUT_INIT": "0000000000000011"
  27865. },
  27866. "attributes": {
  27867. "module_not_derived": "00000000000000000000000000000001",
  27868. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27869. },
  27870. "port_directions": {
  27871. "I0": "input",
  27872. "I1": "input",
  27873. "I2": "input",
  27874. "I3": "input",
  27875. "O": "output"
  27876. },
  27877. "connections": {
  27878. "I0": [ "0" ],
  27879. "I1": [ 457 ],
  27880. "I2": [ 202 ],
  27881. "I3": [ 205 ],
  27882. "O": [ 136 ]
  27883. }
  27884. },
  27885. "cache_bus_I.state_SB_DFF_Q": {
  27886. "hide_name": 0,
  27887. "type": "SB_DFF",
  27888. "parameters": {
  27889. },
  27890. "attributes": {
  27891. "module_not_derived": "00000000000000000000000000000001",
  27892. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  27893. },
  27894. "port_directions": {
  27895. "C": "input",
  27896. "D": "input",
  27897. "Q": "output"
  27898. },
  27899. "connections": {
  27900. "C": [ 42 ],
  27901. "D": [ 919 ],
  27902. "Q": [ 916 ]
  27903. }
  27904. },
  27905. "cache_bus_I.state_SB_DFF_Q_1": {
  27906. "hide_name": 0,
  27907. "type": "SB_DFF",
  27908. "parameters": {
  27909. },
  27910. "attributes": {
  27911. "module_not_derived": "00000000000000000000000000000001",
  27912. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  27913. },
  27914. "port_directions": {
  27915. "C": "input",
  27916. "D": "input",
  27917. "Q": "output"
  27918. },
  27919. "connections": {
  27920. "C": [ 42 ],
  27921. "D": [ 920 ],
  27922. "Q": [ 845 ]
  27923. }
  27924. },
  27925. "cache_bus_I.state_SB_DFF_Q_2": {
  27926. "hide_name": 0,
  27927. "type": "SB_DFF",
  27928. "parameters": {
  27929. },
  27930. "attributes": {
  27931. "module_not_derived": "00000000000000000000000000000001",
  27932. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  27933. },
  27934. "port_directions": {
  27935. "C": "input",
  27936. "D": "input",
  27937. "Q": "output"
  27938. },
  27939. "connections": {
  27940. "C": [ 42 ],
  27941. "D": [ 921 ],
  27942. "Q": [ 470 ]
  27943. }
  27944. },
  27945. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1": {
  27946. "hide_name": 0,
  27947. "type": "SB_LUT4",
  27948. "parameters": {
  27949. "LUT_INIT": "1111111111111100"
  27950. },
  27951. "attributes": {
  27952. "module_not_derived": "00000000000000000000000000000001",
  27953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  27954. },
  27955. "port_directions": {
  27956. "I0": "input",
  27957. "I1": "input",
  27958. "I2": "input",
  27959. "I3": "input",
  27960. "O": "output"
  27961. },
  27962. "connections": {
  27963. "I0": [ "0" ],
  27964. "I1": [ 921 ],
  27965. "I2": [ 920 ],
  27966. "I3": [ 919 ],
  27967. "O": [ 922 ]
  27968. }
  27969. },
  27970. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O_SB_DFF_D": {
  27971. "hide_name": 0,
  27972. "type": "SB_DFF",
  27973. "parameters": {
  27974. },
  27975. "attributes": {
  27976. "module_not_derived": "00000000000000000000000000000001",
  27977. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:130.2-134.23|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  27978. },
  27979. "port_directions": {
  27980. "C": "input",
  27981. "D": "input",
  27982. "Q": "output"
  27983. },
  27984. "connections": {
  27985. "C": [ 42 ],
  27986. "D": [ 923 ],
  27987. "Q": [ 852 ]
  27988. }
  27989. },
  27990. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O_SB_DFF_D_1": {
  27991. "hide_name": 0,
  27992. "type": "SB_DFF",
  27993. "parameters": {
  27994. },
  27995. "attributes": {
  27996. "module_not_derived": "00000000000000000000000000000001",
  27997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:130.2-134.23|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  27998. },
  27999. "port_directions": {
  28000. "C": "input",
  28001. "D": "input",
  28002. "Q": "output"
  28003. },
  28004. "connections": {
  28005. "C": [ 42 ],
  28006. "D": [ 924 ],
  28007. "Q": [ 853 ]
  28008. }
  28009. },
  28010. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O_SB_DFF_D_2": {
  28011. "hide_name": 0,
  28012. "type": "SB_DFF",
  28013. "parameters": {
  28014. },
  28015. "attributes": {
  28016. "module_not_derived": "00000000000000000000000000000001",
  28017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:130.2-134.23|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  28018. },
  28019. "port_directions": {
  28020. "C": "input",
  28021. "D": "input",
  28022. "Q": "output"
  28023. },
  28024. "connections": {
  28025. "C": [ 42 ],
  28026. "D": [ 922 ],
  28027. "Q": [ 854 ]
  28028. }
  28029. },
  28030. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O_SB_LUT4_O": {
  28031. "hide_name": 0,
  28032. "type": "SB_LUT4",
  28033. "parameters": {
  28034. "LUT_INIT": "1111111111111100"
  28035. },
  28036. "attributes": {
  28037. "module_not_derived": "00000000000000000000000000000001",
  28038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28039. },
  28040. "port_directions": {
  28041. "I0": "input",
  28042. "I1": "input",
  28043. "I2": "input",
  28044. "I3": "input",
  28045. "O": "output"
  28046. },
  28047. "connections": {
  28048. "I0": [ "0" ],
  28049. "I1": [ 925 ],
  28050. "I2": [ 926 ],
  28051. "I3": [ 919 ],
  28052. "O": [ 924 ]
  28053. }
  28054. },
  28055. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O_SB_LUT4_O_1": {
  28056. "hide_name": 0,
  28057. "type": "SB_LUT4",
  28058. "parameters": {
  28059. "LUT_INIT": "1111111111111100"
  28060. },
  28061. "attributes": {
  28062. "module_not_derived": "00000000000000000000000000000001",
  28063. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28064. },
  28065. "port_directions": {
  28066. "I0": "input",
  28067. "I1": "input",
  28068. "I2": "input",
  28069. "I3": "input",
  28070. "O": "output"
  28071. },
  28072. "connections": {
  28073. "I0": [ "0" ],
  28074. "I1": [ 925 ],
  28075. "I2": [ 927 ],
  28076. "I3": [ 920 ],
  28077. "O": [ 923 ]
  28078. }
  28079. },
  28080. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O": {
  28081. "hide_name": 0,
  28082. "type": "SB_LUT4",
  28083. "parameters": {
  28084. "LUT_INIT": "1111100010001000"
  28085. },
  28086. "attributes": {
  28087. "module_not_derived": "00000000000000000000000000000001",
  28088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28089. },
  28090. "port_directions": {
  28091. "I0": "input",
  28092. "I1": "input",
  28093. "I2": "input",
  28094. "I3": "input",
  28095. "O": "output"
  28096. },
  28097. "connections": {
  28098. "I0": [ 470 ],
  28099. "I1": [ 928 ],
  28100. "I2": [ 929 ],
  28101. "I3": [ 930 ],
  28102. "O": [ 921 ]
  28103. }
  28104. },
  28105. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_I2": {
  28106. "hide_name": 0,
  28107. "type": "SB_LUT4",
  28108. "parameters": {
  28109. "LUT_INIT": "1111111111000000"
  28110. },
  28111. "attributes": {
  28112. "module_not_derived": "00000000000000000000000000000001",
  28113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28114. },
  28115. "port_directions": {
  28116. "I0": "input",
  28117. "I1": "input",
  28118. "I2": "input",
  28119. "I3": "input",
  28120. "O": "output"
  28121. },
  28122. "connections": {
  28123. "I0": [ "0" ],
  28124. "I1": [ 906 ],
  28125. "I2": [ 928 ],
  28126. "I3": [ 931 ],
  28127. "O": [ 927 ]
  28128. }
  28129. },
  28130. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_I2_O_SB_LUT4_O": {
  28131. "hide_name": 0,
  28132. "type": "SB_LUT4",
  28133. "parameters": {
  28134. "LUT_INIT": "0011001100000011"
  28135. },
  28136. "attributes": {
  28137. "module_not_derived": "00000000000000000000000000000001",
  28138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28139. },
  28140. "port_directions": {
  28141. "I0": "input",
  28142. "I1": "input",
  28143. "I2": "input",
  28144. "I3": "input",
  28145. "O": "output"
  28146. },
  28147. "connections": {
  28148. "I0": [ "0" ],
  28149. "I1": [ 127 ],
  28150. "I2": [ 932 ],
  28151. "I3": [ 897 ],
  28152. "O": [ 920 ]
  28153. }
  28154. },
  28155. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_I2_O_SB_LUT4_O_I2_SB_LUT4_O": {
  28156. "hide_name": 0,
  28157. "type": "SB_LUT4",
  28158. "parameters": {
  28159. "LUT_INIT": "0011111100010101"
  28160. },
  28161. "attributes": {
  28162. "module_not_derived": "00000000000000000000000000000001",
  28163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28164. },
  28165. "port_directions": {
  28166. "I0": "input",
  28167. "I1": "input",
  28168. "I2": "input",
  28169. "I3": "input",
  28170. "O": "output"
  28171. },
  28172. "connections": {
  28173. "I0": [ 845 ],
  28174. "I1": [ 906 ],
  28175. "I2": [ 638 ],
  28176. "I3": [ 849 ],
  28177. "O": [ 932 ]
  28178. }
  28179. },
  28180. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_O": {
  28181. "hide_name": 0,
  28182. "type": "SB_LUT4",
  28183. "parameters": {
  28184. "LUT_INIT": "0000000000001111"
  28185. },
  28186. "attributes": {
  28187. "module_not_derived": "00000000000000000000000000000001",
  28188. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  28189. },
  28190. "port_directions": {
  28191. "I0": "input",
  28192. "I1": "input",
  28193. "I2": "input",
  28194. "I3": "input",
  28195. "O": "output"
  28196. },
  28197. "connections": {
  28198. "I0": [ "0" ],
  28199. "I1": [ "0" ],
  28200. "I2": [ 127 ],
  28201. "I3": [ 638 ],
  28202. "O": [ 928 ]
  28203. }
  28204. },
  28205. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_O_1": {
  28206. "hide_name": 0,
  28207. "type": "SB_LUT4",
  28208. "parameters": {
  28209. "LUT_INIT": "0100000000000000"
  28210. },
  28211. "attributes": {
  28212. "module_not_derived": "00000000000000000000000000000001",
  28213. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28214. },
  28215. "port_directions": {
  28216. "I0": "input",
  28217. "I1": "input",
  28218. "I2": "input",
  28219. "I3": "input",
  28220. "O": "output"
  28221. },
  28222. "connections": {
  28223. "I0": [ 127 ],
  28224. "I1": [ 737 ],
  28225. "I2": [ 733 ],
  28226. "I3": [ 738 ],
  28227. "O": [ 931 ]
  28228. }
  28229. },
  28230. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I2_SB_LUT4_I2": {
  28231. "hide_name": 0,
  28232. "type": "SB_LUT4",
  28233. "parameters": {
  28234. "LUT_INIT": "0000111000000000"
  28235. },
  28236. "attributes": {
  28237. "module_not_derived": "00000000000000000000000000000001",
  28238. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28239. },
  28240. "port_directions": {
  28241. "I0": "input",
  28242. "I1": "input",
  28243. "I2": "input",
  28244. "I3": "input",
  28245. "O": "output"
  28246. },
  28247. "connections": {
  28248. "I0": [ 853 ],
  28249. "I1": [ 740 ],
  28250. "I2": [ 929 ],
  28251. "I3": [ 898 ],
  28252. "O": [ 904 ]
  28253. }
  28254. },
  28255. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I2_SB_LUT4_O": {
  28256. "hide_name": 0,
  28257. "type": "SB_LUT4",
  28258. "parameters": {
  28259. "LUT_INIT": "0011000000000000"
  28260. },
  28261. "attributes": {
  28262. "module_not_derived": "00000000000000000000000000000001",
  28263. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28264. },
  28265. "port_directions": {
  28266. "I0": "input",
  28267. "I1": "input",
  28268. "I2": "input",
  28269. "I3": "input",
  28270. "O": "output"
  28271. },
  28272. "connections": {
  28273. "I0": [ "0" ],
  28274. "I1": [ 735 ],
  28275. "I2": [ 736 ],
  28276. "I3": [ 740 ],
  28277. "O": [ 929 ]
  28278. }
  28279. },
  28280. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_I3": {
  28281. "hide_name": 0,
  28282. "type": "SB_LUT4",
  28283. "parameters": {
  28284. "LUT_INIT": "0001000000000000"
  28285. },
  28286. "attributes": {
  28287. "module_not_derived": "00000000000000000000000000000001",
  28288. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28289. },
  28290. "port_directions": {
  28291. "I0": "input",
  28292. "I1": "input",
  28293. "I2": "input",
  28294. "I3": "input",
  28295. "O": "output"
  28296. },
  28297. "connections": {
  28298. "I0": [ 735 ],
  28299. "I1": [ 736 ],
  28300. "I2": [ 740 ],
  28301. "I3": [ 930 ],
  28302. "O": [ 926 ]
  28303. }
  28304. },
  28305. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  28306. "hide_name": 0,
  28307. "type": "SB_LUT4",
  28308. "parameters": {
  28309. "LUT_INIT": "0000000000001111"
  28310. },
  28311. "attributes": {
  28312. "module_not_derived": "00000000000000000000000000000001",
  28313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  28314. },
  28315. "port_directions": {
  28316. "I0": "input",
  28317. "I1": "input",
  28318. "I2": "input",
  28319. "I3": "input",
  28320. "O": "output"
  28321. },
  28322. "connections": {
  28323. "I0": [ "0" ],
  28324. "I1": [ "0" ],
  28325. "I2": [ 127 ],
  28326. "I3": [ 933 ],
  28327. "O": [ 919 ]
  28328. }
  28329. },
  28330. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O_1": {
  28331. "hide_name": 0,
  28332. "type": "SB_LUT4",
  28333. "parameters": {
  28334. "LUT_INIT": "0000111100000000"
  28335. },
  28336. "attributes": {
  28337. "module_not_derived": "00000000000000000000000000000001",
  28338. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  28339. },
  28340. "port_directions": {
  28341. "I0": "input",
  28342. "I1": "input",
  28343. "I2": "input",
  28344. "I3": "input",
  28345. "O": "output"
  28346. },
  28347. "connections": {
  28348. "I0": [ "0" ],
  28349. "I1": [ "0" ],
  28350. "I2": [ 127 ],
  28351. "I3": [ 903 ],
  28352. "O": [ 925 ]
  28353. }
  28354. },
  28355. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O": {
  28356. "hide_name": 0,
  28357. "type": "SB_LUT4",
  28358. "parameters": {
  28359. "LUT_INIT": "0000011100001111"
  28360. },
  28361. "attributes": {
  28362. "module_not_derived": "00000000000000000000000000000001",
  28363. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28364. },
  28365. "port_directions": {
  28366. "I0": "input",
  28367. "I1": "input",
  28368. "I2": "input",
  28369. "I3": "input",
  28370. "O": "output"
  28371. },
  28372. "connections": {
  28373. "I0": [ 735 ],
  28374. "I1": [ 740 ],
  28375. "I2": [ 911 ],
  28376. "I3": [ 898 ],
  28377. "O": [ 933 ]
  28378. }
  28379. },
  28380. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_O": {
  28381. "hide_name": 0,
  28382. "type": "SB_LUT4",
  28383. "parameters": {
  28384. "LUT_INIT": "0000000000110000"
  28385. },
  28386. "attributes": {
  28387. "module_not_derived": "00000000000000000000000000000001",
  28388. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28389. },
  28390. "port_directions": {
  28391. "I0": "input",
  28392. "I1": "input",
  28393. "I2": "input",
  28394. "I3": "input",
  28395. "O": "output"
  28396. },
  28397. "connections": {
  28398. "I0": [ "0" ],
  28399. "I1": [ 127 ],
  28400. "I2": [ 733 ],
  28401. "I3": [ 738 ],
  28402. "O": [ 930 ]
  28403. }
  28404. },
  28405. "cache_bus_I.state_SB_DFF_Q_3": {
  28406. "hide_name": 0,
  28407. "type": "SB_DFF",
  28408. "parameters": {
  28409. },
  28410. "attributes": {
  28411. "module_not_derived": "00000000000000000000000000000001",
  28412. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  28413. },
  28414. "port_directions": {
  28415. "C": "input",
  28416. "D": "input",
  28417. "Q": "output"
  28418. },
  28419. "connections": {
  28420. "C": [ 42 ],
  28421. "D": [ 925 ],
  28422. "Q": [ 913 ]
  28423. }
  28424. },
  28425. "cache_bus_I.state_SB_DFF_Q_4": {
  28426. "hide_name": 0,
  28427. "type": "SB_DFF",
  28428. "parameters": {
  28429. },
  28430. "attributes": {
  28431. "module_not_derived": "00000000000000000000000000000001",
  28432. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  28433. },
  28434. "port_directions": {
  28435. "C": "input",
  28436. "D": "input",
  28437. "Q": "output"
  28438. },
  28439. "connections": {
  28440. "C": [ 42 ],
  28441. "D": [ 926 ],
  28442. "Q": [ 914 ]
  28443. }
  28444. },
  28445. "cache_bus_I.state_SB_DFF_Q_5": {
  28446. "hide_name": 0,
  28447. "type": "SB_DFF",
  28448. "parameters": {
  28449. },
  28450. "attributes": {
  28451. "module_not_derived": "00000000000000000000000000000001",
  28452. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  28453. },
  28454. "port_directions": {
  28455. "C": "input",
  28456. "D": "input",
  28457. "Q": "output"
  28458. },
  28459. "connections": {
  28460. "C": [ 42 ],
  28461. "D": [ 927 ],
  28462. "Q": [ 906 ]
  28463. }
  28464. },
  28465. "cache_bus_I.state_SB_DFF_Q_6": {
  28466. "hide_name": 0,
  28467. "type": "SB_DFF",
  28468. "parameters": {
  28469. },
  28470. "attributes": {
  28471. "module_not_derived": "00000000000000000000000000000001",
  28472. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  28473. },
  28474. "port_directions": {
  28475. "C": "input",
  28476. "D": "input",
  28477. "Q": "output"
  28478. },
  28479. "connections": {
  28480. "C": [ 42 ],
  28481. "D": [ 934 ],
  28482. "Q": [ 733 ]
  28483. }
  28484. },
  28485. "cache_bus_I.state_SB_DFF_Q_6_D_SB_LUT4_O": {
  28486. "hide_name": 0,
  28487. "type": "SB_LUT4",
  28488. "parameters": {
  28489. "LUT_INIT": "0011000011111111"
  28490. },
  28491. "attributes": {
  28492. "module_not_derived": "00000000000000000000000000000001",
  28493. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  28494. },
  28495. "port_directions": {
  28496. "I0": "input",
  28497. "I1": "input",
  28498. "I2": "input",
  28499. "I3": "input",
  28500. "O": "output"
  28501. },
  28502. "connections": {
  28503. "I0": [ "0" ],
  28504. "I1": [ 740 ],
  28505. "I2": [ 930 ],
  28506. "I3": [ 935 ],
  28507. "O": [ 934 ]
  28508. }
  28509. },
  28510. "cache_bus_I.state_SB_DFF_Q_6_D_SB_LUT4_O_I3_SB_LUT4_O": {
  28511. "hide_name": 0,
  28512. "type": "SB_LUT4",
  28513. "parameters": {
  28514. "LUT_INIT": "1101111100000000"
  28515. },
  28516. "attributes": {
  28517. "module_not_derived": "00000000000000000000000000000001",
  28518. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28519. },
  28520. "port_directions": {
  28521. "I0": "input",
  28522. "I1": "input",
  28523. "I2": "input",
  28524. "I3": "input",
  28525. "O": "output"
  28526. },
  28527. "connections": {
  28528. "I0": [ 845 ],
  28529. "I1": [ 734 ],
  28530. "I2": [ 849 ],
  28531. "I3": [ 936 ],
  28532. "O": [ 935 ]
  28533. }
  28534. },
  28535. "cache_bus_I.state_SB_DFF_Q_6_D_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  28536. "hide_name": 0,
  28537. "type": "SB_LUT4",
  28538. "parameters": {
  28539. "LUT_INIT": "0000000100000000"
  28540. },
  28541. "attributes": {
  28542. "module_not_derived": "00000000000000000000000000000001",
  28543. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28544. },
  28545. "port_directions": {
  28546. "I0": "input",
  28547. "I1": "input",
  28548. "I2": "input",
  28549. "I3": "input",
  28550. "O": "output"
  28551. },
  28552. "connections": {
  28553. "I0": [ 127 ],
  28554. "I1": [ 913 ],
  28555. "I2": [ 914 ],
  28556. "I3": [ 937 ],
  28557. "O": [ 936 ]
  28558. }
  28559. },
  28560. "cache_bus_I.wb_ack_i_SB_DFF_Q": {
  28561. "hide_name": 0,
  28562. "type": "SB_DFF",
  28563. "parameters": {
  28564. },
  28565. "attributes": {
  28566. "module_not_derived": "00000000000000000000000000000001",
  28567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:291.2-292.23|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  28568. },
  28569. "port_directions": {
  28570. "C": "input",
  28571. "D": "input",
  28572. "Q": "output"
  28573. },
  28574. "connections": {
  28575. "C": [ 42 ],
  28576. "D": [ 938 ],
  28577. "Q": [ 939 ]
  28578. }
  28579. },
  28580. "cache_bus_I.wb_ack_i_SB_LUT4_I2": {
  28581. "hide_name": 0,
  28582. "type": "SB_LUT4",
  28583. "parameters": {
  28584. "LUT_INIT": "0001001101011111"
  28585. },
  28586. "attributes": {
  28587. "module_not_derived": "00000000000000000000000000000001",
  28588. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28589. },
  28590. "port_directions": {
  28591. "I0": "input",
  28592. "I1": "input",
  28593. "I2": "input",
  28594. "I3": "input",
  28595. "O": "output"
  28596. },
  28597. "connections": {
  28598. "I0": [ 916 ],
  28599. "I1": [ 470 ],
  28600. "I2": [ 939 ],
  28601. "I3": [ 638 ],
  28602. "O": [ 937 ]
  28603. }
  28604. },
  28605. "cache_bus_I.wb_ack_i_SB_LUT4_I2_O_SB_DFFR_Q": {
  28606. "hide_name": 0,
  28607. "type": "SB_DFFR",
  28608. "parameters": {
  28609. },
  28610. "attributes": {
  28611. "module_not_derived": "00000000000000000000000000000001",
  28612. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  28613. },
  28614. "port_directions": {
  28615. "C": "input",
  28616. "D": "input",
  28617. "Q": "output",
  28618. "R": "input"
  28619. },
  28620. "connections": {
  28621. "C": [ 42 ],
  28622. "D": [ 940 ],
  28623. "Q": [ 740 ],
  28624. "R": [ 127 ]
  28625. }
  28626. },
  28627. "cache_bus_I.wb_ack_i_SB_LUT4_I2_O_SB_DFFR_Q_D_SB_LUT4_O": {
  28628. "hide_name": 0,
  28629. "type": "SB_LUT4",
  28630. "parameters": {
  28631. "LUT_INIT": "0111001101000000"
  28632. },
  28633. "attributes": {
  28634. "module_not_derived": "00000000000000000000000000000001",
  28635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  28636. },
  28637. "port_directions": {
  28638. "I0": "input",
  28639. "I1": "input",
  28640. "I2": "input",
  28641. "I3": "input",
  28642. "O": "output"
  28643. },
  28644. "connections": {
  28645. "I0": [ 914 ],
  28646. "I1": [ 740 ],
  28647. "I2": [ 937 ],
  28648. "I3": [ 941 ],
  28649. "O": [ 940 ]
  28650. }
  28651. },
  28652. "cache_bus_I.wb_ack_i_SB_LUT4_I2_O_SB_LUT4_I3": {
  28653. "hide_name": 0,
  28654. "type": "SB_LUT4",
  28655. "parameters": {
  28656. "LUT_INIT": "0000000011111111"
  28657. },
  28658. "attributes": {
  28659. "module_not_derived": "00000000000000000000000000000001",
  28660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  28661. },
  28662. "port_directions": {
  28663. "I0": "input",
  28664. "I1": "input",
  28665. "I2": "input",
  28666. "I3": "input",
  28667. "O": "output"
  28668. },
  28669. "connections": {
  28670. "I0": [ "0" ],
  28671. "I1": [ "0" ],
  28672. "I2": [ "0" ],
  28673. "I3": [ 740 ],
  28674. "O": [ 942 ]
  28675. }
  28676. },
  28677. "cache_bus_I.wb_ack_i_SB_LUT4_I3": {
  28678. "hide_name": 0,
  28679. "type": "SB_LUT4",
  28680. "parameters": {
  28681. "LUT_INIT": "0000000011110000"
  28682. },
  28683. "attributes": {
  28684. "module_not_derived": "00000000000000000000000000000001",
  28685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  28686. },
  28687. "port_directions": {
  28688. "I0": "input",
  28689. "I1": "input",
  28690. "I2": "input",
  28691. "I3": "input",
  28692. "O": "output"
  28693. },
  28694. "connections": {
  28695. "I0": [ "0" ],
  28696. "I1": [ "0" ],
  28697. "I2": [ 916 ],
  28698. "I3": [ 939 ],
  28699. "O": [ 911 ]
  28700. }
  28701. },
  28702. "cache_bus_I.wb_ack_i_SB_LUT4_I3_O_SB_LUT4_O": {
  28703. "hide_name": 0,
  28704. "type": "SB_LUT4",
  28705. "parameters": {
  28706. "LUT_INIT": "0000000011110000"
  28707. },
  28708. "attributes": {
  28709. "module_not_derived": "00000000000000000000000000000001",
  28710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  28711. },
  28712. "port_directions": {
  28713. "I0": "input",
  28714. "I1": "input",
  28715. "I2": "input",
  28716. "I3": "input",
  28717. "O": "output"
  28718. },
  28719. "connections": {
  28720. "I0": [ "0" ],
  28721. "I1": [ "0" ],
  28722. "I2": [ 733 ],
  28723. "I3": [ 738 ],
  28724. "O": [ 898 ]
  28725. }
  28726. },
  28727. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q": {
  28728. "hide_name": 0,
  28729. "type": "SB_DFFE",
  28730. "parameters": {
  28731. },
  28732. "attributes": {
  28733. "module_not_derived": "00000000000000000000000000000001",
  28734. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28735. },
  28736. "port_directions": {
  28737. "C": "input",
  28738. "D": "input",
  28739. "E": "input",
  28740. "Q": "output"
  28741. },
  28742. "connections": {
  28743. "C": [ 42 ],
  28744. "D": [ 943 ],
  28745. "E": [ 944 ],
  28746. "Q": [ 945 ]
  28747. }
  28748. },
  28749. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_1": {
  28750. "hide_name": 0,
  28751. "type": "SB_DFFE",
  28752. "parameters": {
  28753. },
  28754. "attributes": {
  28755. "module_not_derived": "00000000000000000000000000000001",
  28756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28757. },
  28758. "port_directions": {
  28759. "C": "input",
  28760. "D": "input",
  28761. "E": "input",
  28762. "Q": "output"
  28763. },
  28764. "connections": {
  28765. "C": [ 42 ],
  28766. "D": [ 946 ],
  28767. "E": [ 944 ],
  28768. "Q": [ 947 ]
  28769. }
  28770. },
  28771. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_10": {
  28772. "hide_name": 0,
  28773. "type": "SB_DFFE",
  28774. "parameters": {
  28775. },
  28776. "attributes": {
  28777. "module_not_derived": "00000000000000000000000000000001",
  28778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28779. },
  28780. "port_directions": {
  28781. "C": "input",
  28782. "D": "input",
  28783. "E": "input",
  28784. "Q": "output"
  28785. },
  28786. "connections": {
  28787. "C": [ 42 ],
  28788. "D": [ 948 ],
  28789. "E": [ 944 ],
  28790. "Q": [ 949 ]
  28791. }
  28792. },
  28793. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_11": {
  28794. "hide_name": 0,
  28795. "type": "SB_DFFE",
  28796. "parameters": {
  28797. },
  28798. "attributes": {
  28799. "module_not_derived": "00000000000000000000000000000001",
  28800. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28801. },
  28802. "port_directions": {
  28803. "C": "input",
  28804. "D": "input",
  28805. "E": "input",
  28806. "Q": "output"
  28807. },
  28808. "connections": {
  28809. "C": [ 42 ],
  28810. "D": [ 950 ],
  28811. "E": [ 944 ],
  28812. "Q": [ 951 ]
  28813. }
  28814. },
  28815. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_12": {
  28816. "hide_name": 0,
  28817. "type": "SB_DFFE",
  28818. "parameters": {
  28819. },
  28820. "attributes": {
  28821. "module_not_derived": "00000000000000000000000000000001",
  28822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28823. },
  28824. "port_directions": {
  28825. "C": "input",
  28826. "D": "input",
  28827. "E": "input",
  28828. "Q": "output"
  28829. },
  28830. "connections": {
  28831. "C": [ 42 ],
  28832. "D": [ 952 ],
  28833. "E": [ 944 ],
  28834. "Q": [ 953 ]
  28835. }
  28836. },
  28837. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_13": {
  28838. "hide_name": 0,
  28839. "type": "SB_DFFE",
  28840. "parameters": {
  28841. },
  28842. "attributes": {
  28843. "module_not_derived": "00000000000000000000000000000001",
  28844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28845. },
  28846. "port_directions": {
  28847. "C": "input",
  28848. "D": "input",
  28849. "E": "input",
  28850. "Q": "output"
  28851. },
  28852. "connections": {
  28853. "C": [ 42 ],
  28854. "D": [ 954 ],
  28855. "E": [ 944 ],
  28856. "Q": [ 955 ]
  28857. }
  28858. },
  28859. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_14": {
  28860. "hide_name": 0,
  28861. "type": "SB_DFFE",
  28862. "parameters": {
  28863. },
  28864. "attributes": {
  28865. "module_not_derived": "00000000000000000000000000000001",
  28866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28867. },
  28868. "port_directions": {
  28869. "C": "input",
  28870. "D": "input",
  28871. "E": "input",
  28872. "Q": "output"
  28873. },
  28874. "connections": {
  28875. "C": [ 42 ],
  28876. "D": [ 956 ],
  28877. "E": [ 944 ],
  28878. "Q": [ 957 ]
  28879. }
  28880. },
  28881. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_15": {
  28882. "hide_name": 0,
  28883. "type": "SB_DFFE",
  28884. "parameters": {
  28885. },
  28886. "attributes": {
  28887. "module_not_derived": "00000000000000000000000000000001",
  28888. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28889. },
  28890. "port_directions": {
  28891. "C": "input",
  28892. "D": "input",
  28893. "E": "input",
  28894. "Q": "output"
  28895. },
  28896. "connections": {
  28897. "C": [ 42 ],
  28898. "D": [ 958 ],
  28899. "E": [ 944 ],
  28900. "Q": [ 959 ]
  28901. }
  28902. },
  28903. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_16": {
  28904. "hide_name": 0,
  28905. "type": "SB_DFFE",
  28906. "parameters": {
  28907. },
  28908. "attributes": {
  28909. "module_not_derived": "00000000000000000000000000000001",
  28910. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28911. },
  28912. "port_directions": {
  28913. "C": "input",
  28914. "D": "input",
  28915. "E": "input",
  28916. "Q": "output"
  28917. },
  28918. "connections": {
  28919. "C": [ 42 ],
  28920. "D": [ 960 ],
  28921. "E": [ 944 ],
  28922. "Q": [ 961 ]
  28923. }
  28924. },
  28925. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_17": {
  28926. "hide_name": 0,
  28927. "type": "SB_DFFE",
  28928. "parameters": {
  28929. },
  28930. "attributes": {
  28931. "module_not_derived": "00000000000000000000000000000001",
  28932. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28933. },
  28934. "port_directions": {
  28935. "C": "input",
  28936. "D": "input",
  28937. "E": "input",
  28938. "Q": "output"
  28939. },
  28940. "connections": {
  28941. "C": [ 42 ],
  28942. "D": [ 962 ],
  28943. "E": [ 944 ],
  28944. "Q": [ 963 ]
  28945. }
  28946. },
  28947. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_18": {
  28948. "hide_name": 0,
  28949. "type": "SB_DFFE",
  28950. "parameters": {
  28951. },
  28952. "attributes": {
  28953. "module_not_derived": "00000000000000000000000000000001",
  28954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28955. },
  28956. "port_directions": {
  28957. "C": "input",
  28958. "D": "input",
  28959. "E": "input",
  28960. "Q": "output"
  28961. },
  28962. "connections": {
  28963. "C": [ 42 ],
  28964. "D": [ 964 ],
  28965. "E": [ 944 ],
  28966. "Q": [ 965 ]
  28967. }
  28968. },
  28969. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_19": {
  28970. "hide_name": 0,
  28971. "type": "SB_DFFE",
  28972. "parameters": {
  28973. },
  28974. "attributes": {
  28975. "module_not_derived": "00000000000000000000000000000001",
  28976. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28977. },
  28978. "port_directions": {
  28979. "C": "input",
  28980. "D": "input",
  28981. "E": "input",
  28982. "Q": "output"
  28983. },
  28984. "connections": {
  28985. "C": [ 42 ],
  28986. "D": [ 966 ],
  28987. "E": [ 944 ],
  28988. "Q": [ 967 ]
  28989. }
  28990. },
  28991. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_2": {
  28992. "hide_name": 0,
  28993. "type": "SB_DFFE",
  28994. "parameters": {
  28995. },
  28996. "attributes": {
  28997. "module_not_derived": "00000000000000000000000000000001",
  28998. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  28999. },
  29000. "port_directions": {
  29001. "C": "input",
  29002. "D": "input",
  29003. "E": "input",
  29004. "Q": "output"
  29005. },
  29006. "connections": {
  29007. "C": [ 42 ],
  29008. "D": [ 968 ],
  29009. "E": [ 944 ],
  29010. "Q": [ 969 ]
  29011. }
  29012. },
  29013. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_20": {
  29014. "hide_name": 0,
  29015. "type": "SB_DFFE",
  29016. "parameters": {
  29017. },
  29018. "attributes": {
  29019. "module_not_derived": "00000000000000000000000000000001",
  29020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29021. },
  29022. "port_directions": {
  29023. "C": "input",
  29024. "D": "input",
  29025. "E": "input",
  29026. "Q": "output"
  29027. },
  29028. "connections": {
  29029. "C": [ 42 ],
  29030. "D": [ 970 ],
  29031. "E": [ 944 ],
  29032. "Q": [ 971 ]
  29033. }
  29034. },
  29035. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_21": {
  29036. "hide_name": 0,
  29037. "type": "SB_DFFE",
  29038. "parameters": {
  29039. },
  29040. "attributes": {
  29041. "module_not_derived": "00000000000000000000000000000001",
  29042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29043. },
  29044. "port_directions": {
  29045. "C": "input",
  29046. "D": "input",
  29047. "E": "input",
  29048. "Q": "output"
  29049. },
  29050. "connections": {
  29051. "C": [ 42 ],
  29052. "D": [ 972 ],
  29053. "E": [ 944 ],
  29054. "Q": [ 973 ]
  29055. }
  29056. },
  29057. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_22": {
  29058. "hide_name": 0,
  29059. "type": "SB_DFFE",
  29060. "parameters": {
  29061. },
  29062. "attributes": {
  29063. "module_not_derived": "00000000000000000000000000000001",
  29064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29065. },
  29066. "port_directions": {
  29067. "C": "input",
  29068. "D": "input",
  29069. "E": "input",
  29070. "Q": "output"
  29071. },
  29072. "connections": {
  29073. "C": [ 42 ],
  29074. "D": [ 974 ],
  29075. "E": [ 944 ],
  29076. "Q": [ 975 ]
  29077. }
  29078. },
  29079. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_23": {
  29080. "hide_name": 0,
  29081. "type": "SB_DFFE",
  29082. "parameters": {
  29083. },
  29084. "attributes": {
  29085. "module_not_derived": "00000000000000000000000000000001",
  29086. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29087. },
  29088. "port_directions": {
  29089. "C": "input",
  29090. "D": "input",
  29091. "E": "input",
  29092. "Q": "output"
  29093. },
  29094. "connections": {
  29095. "C": [ 42 ],
  29096. "D": [ 976 ],
  29097. "E": [ 944 ],
  29098. "Q": [ 977 ]
  29099. }
  29100. },
  29101. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_24": {
  29102. "hide_name": 0,
  29103. "type": "SB_DFFE",
  29104. "parameters": {
  29105. },
  29106. "attributes": {
  29107. "module_not_derived": "00000000000000000000000000000001",
  29108. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29109. },
  29110. "port_directions": {
  29111. "C": "input",
  29112. "D": "input",
  29113. "E": "input",
  29114. "Q": "output"
  29115. },
  29116. "connections": {
  29117. "C": [ 42 ],
  29118. "D": [ 978 ],
  29119. "E": [ 944 ],
  29120. "Q": [ 979 ]
  29121. }
  29122. },
  29123. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_25": {
  29124. "hide_name": 0,
  29125. "type": "SB_DFFE",
  29126. "parameters": {
  29127. },
  29128. "attributes": {
  29129. "module_not_derived": "00000000000000000000000000000001",
  29130. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29131. },
  29132. "port_directions": {
  29133. "C": "input",
  29134. "D": "input",
  29135. "E": "input",
  29136. "Q": "output"
  29137. },
  29138. "connections": {
  29139. "C": [ 42 ],
  29140. "D": [ 980 ],
  29141. "E": [ 944 ],
  29142. "Q": [ 981 ]
  29143. }
  29144. },
  29145. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_26": {
  29146. "hide_name": 0,
  29147. "type": "SB_DFFE",
  29148. "parameters": {
  29149. },
  29150. "attributes": {
  29151. "module_not_derived": "00000000000000000000000000000001",
  29152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29153. },
  29154. "port_directions": {
  29155. "C": "input",
  29156. "D": "input",
  29157. "E": "input",
  29158. "Q": "output"
  29159. },
  29160. "connections": {
  29161. "C": [ 42 ],
  29162. "D": [ 982 ],
  29163. "E": [ 944 ],
  29164. "Q": [ 983 ]
  29165. }
  29166. },
  29167. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_27": {
  29168. "hide_name": 0,
  29169. "type": "SB_DFFE",
  29170. "parameters": {
  29171. },
  29172. "attributes": {
  29173. "module_not_derived": "00000000000000000000000000000001",
  29174. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29175. },
  29176. "port_directions": {
  29177. "C": "input",
  29178. "D": "input",
  29179. "E": "input",
  29180. "Q": "output"
  29181. },
  29182. "connections": {
  29183. "C": [ 42 ],
  29184. "D": [ 984 ],
  29185. "E": [ 944 ],
  29186. "Q": [ 985 ]
  29187. }
  29188. },
  29189. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_28": {
  29190. "hide_name": 0,
  29191. "type": "SB_DFFE",
  29192. "parameters": {
  29193. },
  29194. "attributes": {
  29195. "module_not_derived": "00000000000000000000000000000001",
  29196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29197. },
  29198. "port_directions": {
  29199. "C": "input",
  29200. "D": "input",
  29201. "E": "input",
  29202. "Q": "output"
  29203. },
  29204. "connections": {
  29205. "C": [ 42 ],
  29206. "D": [ 986 ],
  29207. "E": [ 944 ],
  29208. "Q": [ 987 ]
  29209. }
  29210. },
  29211. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_29": {
  29212. "hide_name": 0,
  29213. "type": "SB_DFFE",
  29214. "parameters": {
  29215. },
  29216. "attributes": {
  29217. "module_not_derived": "00000000000000000000000000000001",
  29218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29219. },
  29220. "port_directions": {
  29221. "C": "input",
  29222. "D": "input",
  29223. "E": "input",
  29224. "Q": "output"
  29225. },
  29226. "connections": {
  29227. "C": [ 42 ],
  29228. "D": [ 988 ],
  29229. "E": [ 944 ],
  29230. "Q": [ 989 ]
  29231. }
  29232. },
  29233. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_3": {
  29234. "hide_name": 0,
  29235. "type": "SB_DFFE",
  29236. "parameters": {
  29237. },
  29238. "attributes": {
  29239. "module_not_derived": "00000000000000000000000000000001",
  29240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29241. },
  29242. "port_directions": {
  29243. "C": "input",
  29244. "D": "input",
  29245. "E": "input",
  29246. "Q": "output"
  29247. },
  29248. "connections": {
  29249. "C": [ 42 ],
  29250. "D": [ 990 ],
  29251. "E": [ 944 ],
  29252. "Q": [ 991 ]
  29253. }
  29254. },
  29255. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_30": {
  29256. "hide_name": 0,
  29257. "type": "SB_DFFE",
  29258. "parameters": {
  29259. },
  29260. "attributes": {
  29261. "module_not_derived": "00000000000000000000000000000001",
  29262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29263. },
  29264. "port_directions": {
  29265. "C": "input",
  29266. "D": "input",
  29267. "E": "input",
  29268. "Q": "output"
  29269. },
  29270. "connections": {
  29271. "C": [ 42 ],
  29272. "D": [ 992 ],
  29273. "E": [ 944 ],
  29274. "Q": [ 993 ]
  29275. }
  29276. },
  29277. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_31": {
  29278. "hide_name": 0,
  29279. "type": "SB_DFFE",
  29280. "parameters": {
  29281. },
  29282. "attributes": {
  29283. "module_not_derived": "00000000000000000000000000000001",
  29284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29285. },
  29286. "port_directions": {
  29287. "C": "input",
  29288. "D": "input",
  29289. "E": "input",
  29290. "Q": "output"
  29291. },
  29292. "connections": {
  29293. "C": [ 42 ],
  29294. "D": [ 994 ],
  29295. "E": [ 944 ],
  29296. "Q": [ 995 ]
  29297. }
  29298. },
  29299. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_4": {
  29300. "hide_name": 0,
  29301. "type": "SB_DFFE",
  29302. "parameters": {
  29303. },
  29304. "attributes": {
  29305. "module_not_derived": "00000000000000000000000000000001",
  29306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29307. },
  29308. "port_directions": {
  29309. "C": "input",
  29310. "D": "input",
  29311. "E": "input",
  29312. "Q": "output"
  29313. },
  29314. "connections": {
  29315. "C": [ 42 ],
  29316. "D": [ 996 ],
  29317. "E": [ 944 ],
  29318. "Q": [ 997 ]
  29319. }
  29320. },
  29321. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_5": {
  29322. "hide_name": 0,
  29323. "type": "SB_DFFE",
  29324. "parameters": {
  29325. },
  29326. "attributes": {
  29327. "module_not_derived": "00000000000000000000000000000001",
  29328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29329. },
  29330. "port_directions": {
  29331. "C": "input",
  29332. "D": "input",
  29333. "E": "input",
  29334. "Q": "output"
  29335. },
  29336. "connections": {
  29337. "C": [ 42 ],
  29338. "D": [ 998 ],
  29339. "E": [ 944 ],
  29340. "Q": [ 999 ]
  29341. }
  29342. },
  29343. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_6": {
  29344. "hide_name": 0,
  29345. "type": "SB_DFFE",
  29346. "parameters": {
  29347. },
  29348. "attributes": {
  29349. "module_not_derived": "00000000000000000000000000000001",
  29350. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29351. },
  29352. "port_directions": {
  29353. "C": "input",
  29354. "D": "input",
  29355. "E": "input",
  29356. "Q": "output"
  29357. },
  29358. "connections": {
  29359. "C": [ 42 ],
  29360. "D": [ 1000 ],
  29361. "E": [ 944 ],
  29362. "Q": [ 1001 ]
  29363. }
  29364. },
  29365. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_7": {
  29366. "hide_name": 0,
  29367. "type": "SB_DFFE",
  29368. "parameters": {
  29369. },
  29370. "attributes": {
  29371. "module_not_derived": "00000000000000000000000000000001",
  29372. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29373. },
  29374. "port_directions": {
  29375. "C": "input",
  29376. "D": "input",
  29377. "E": "input",
  29378. "Q": "output"
  29379. },
  29380. "connections": {
  29381. "C": [ 42 ],
  29382. "D": [ 1002 ],
  29383. "E": [ 944 ],
  29384. "Q": [ 1003 ]
  29385. }
  29386. },
  29387. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_8": {
  29388. "hide_name": 0,
  29389. "type": "SB_DFFE",
  29390. "parameters": {
  29391. },
  29392. "attributes": {
  29393. "module_not_derived": "00000000000000000000000000000001",
  29394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29395. },
  29396. "port_directions": {
  29397. "C": "input",
  29398. "D": "input",
  29399. "E": "input",
  29400. "Q": "output"
  29401. },
  29402. "connections": {
  29403. "C": [ 42 ],
  29404. "D": [ 1004 ],
  29405. "E": [ 944 ],
  29406. "Q": [ 1005 ]
  29407. }
  29408. },
  29409. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr_SB_DFFE_Q_9": {
  29410. "hide_name": 0,
  29411. "type": "SB_DFFE",
  29412. "parameters": {
  29413. },
  29414. "attributes": {
  29415. "module_not_derived": "00000000000000000000000000000001",
  29416. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  29417. },
  29418. "port_directions": {
  29419. "C": "input",
  29420. "D": "input",
  29421. "E": "input",
  29422. "Q": "output"
  29423. },
  29424. "connections": {
  29425. "C": [ 42 ],
  29426. "D": [ 1006 ],
  29427. "E": [ 944 ],
  29428. "Q": [ 1007 ]
  29429. }
  29430. },
  29431. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D": {
  29432. "hide_name": 0,
  29433. "type": "SB_DFFR",
  29434. "parameters": {
  29435. },
  29436. "attributes": {
  29437. "module_not_derived": "00000000000000000000000000000001",
  29438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29439. },
  29440. "port_directions": {
  29441. "C": "input",
  29442. "D": "input",
  29443. "Q": "output",
  29444. "R": "input"
  29445. },
  29446. "connections": {
  29447. "C": [ 42 ],
  29448. "D": [ 1008 ],
  29449. "Q": [ 1009 ],
  29450. "R": [ 127 ]
  29451. }
  29452. },
  29453. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q": {
  29454. "hide_name": 0,
  29455. "type": "SB_DFFR",
  29456. "parameters": {
  29457. },
  29458. "attributes": {
  29459. "module_not_derived": "00000000000000000000000000000001",
  29460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29461. },
  29462. "port_directions": {
  29463. "C": "input",
  29464. "D": "input",
  29465. "Q": "output",
  29466. "R": "input"
  29467. },
  29468. "connections": {
  29469. "C": [ 42 ],
  29470. "D": [ 1010 ],
  29471. "Q": [ 1011 ],
  29472. "R": [ 127 ]
  29473. }
  29474. },
  29475. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_1": {
  29476. "hide_name": 0,
  29477. "type": "SB_DFFR",
  29478. "parameters": {
  29479. },
  29480. "attributes": {
  29481. "module_not_derived": "00000000000000000000000000000001",
  29482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29483. },
  29484. "port_directions": {
  29485. "C": "input",
  29486. "D": "input",
  29487. "Q": "output",
  29488. "R": "input"
  29489. },
  29490. "connections": {
  29491. "C": [ 42 ],
  29492. "D": [ 1012 ],
  29493. "Q": [ 1013 ],
  29494. "R": [ 127 ]
  29495. }
  29496. },
  29497. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O": {
  29498. "hide_name": 0,
  29499. "type": "SB_LUT4",
  29500. "parameters": {
  29501. "LUT_INIT": "1111000000000000"
  29502. },
  29503. "attributes": {
  29504. "module_not_derived": "00000000000000000000000000000001",
  29505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  29506. },
  29507. "port_directions": {
  29508. "I0": "input",
  29509. "I1": "input",
  29510. "I2": "input",
  29511. "I3": "input",
  29512. "O": "output"
  29513. },
  29514. "connections": {
  29515. "I0": [ "0" ],
  29516. "I1": [ "0" ],
  29517. "I2": [ 1014 ],
  29518. "I3": [ 1015 ],
  29519. "O": [ 1010 ]
  29520. }
  29521. },
  29522. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I2_SB_DFFR_Q": {
  29523. "hide_name": 0,
  29524. "type": "SB_DFFR",
  29525. "parameters": {
  29526. },
  29527. "attributes": {
  29528. "module_not_derived": "00000000000000000000000000000001",
  29529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29530. },
  29531. "port_directions": {
  29532. "C": "input",
  29533. "D": "input",
  29534. "Q": "output",
  29535. "R": "input"
  29536. },
  29537. "connections": {
  29538. "C": [ 42 ],
  29539. "D": [ 1016 ],
  29540. "Q": [ 1014 ],
  29541. "R": [ 127 ]
  29542. }
  29543. },
  29544. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I2_SB_LUT4_I0": {
  29545. "hide_name": 0,
  29546. "type": "SB_LUT4",
  29547. "parameters": {
  29548. "LUT_INIT": "1010110000000000"
  29549. },
  29550. "attributes": {
  29551. "module_not_derived": "00000000000000000000000000000001",
  29552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  29553. },
  29554. "port_directions": {
  29555. "I0": "input",
  29556. "I1": "input",
  29557. "I2": "input",
  29558. "I3": "input",
  29559. "O": "output"
  29560. },
  29561. "connections": {
  29562. "I0": [ 1014 ],
  29563. "I1": [ 1017 ],
  29564. "I2": [ 1018 ],
  29565. "I3": [ 1015 ],
  29566. "O": [ 1016 ]
  29567. }
  29568. },
  29569. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_DFFR_Q": {
  29570. "hide_name": 0,
  29571. "type": "SB_DFFR",
  29572. "parameters": {
  29573. },
  29574. "attributes": {
  29575. "module_not_derived": "00000000000000000000000000000001",
  29576. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29577. },
  29578. "port_directions": {
  29579. "C": "input",
  29580. "D": "input",
  29581. "Q": "output",
  29582. "R": "input"
  29583. },
  29584. "connections": {
  29585. "C": [ 42 ],
  29586. "D": [ 1019 ],
  29587. "Q": [ 1017 ],
  29588. "R": [ 127 ]
  29589. }
  29590. },
  29591. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_DFFR_Q_D_SB_LUT4_O": {
  29592. "hide_name": 0,
  29593. "type": "SB_LUT4",
  29594. "parameters": {
  29595. "LUT_INIT": "1100111100000000"
  29596. },
  29597. "attributes": {
  29598. "module_not_derived": "00000000000000000000000000000001",
  29599. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  29600. },
  29601. "port_directions": {
  29602. "I0": "input",
  29603. "I1": "input",
  29604. "I2": "input",
  29605. "I3": "input",
  29606. "O": "output"
  29607. },
  29608. "connections": {
  29609. "I0": [ "0" ],
  29610. "I1": [ 1017 ],
  29611. "I2": [ 1020 ],
  29612. "I3": [ 1015 ],
  29613. "O": [ 1019 ]
  29614. }
  29615. },
  29616. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_Q": {
  29617. "hide_name": 0,
  29618. "type": "SB_DFFR",
  29619. "parameters": {
  29620. },
  29621. "attributes": {
  29622. "module_not_derived": "00000000000000000000000000000001",
  29623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29624. },
  29625. "port_directions": {
  29626. "C": "input",
  29627. "D": "input",
  29628. "Q": "output",
  29629. "R": "input"
  29630. },
  29631. "connections": {
  29632. "C": [ 42 ],
  29633. "D": [ 1021 ],
  29634. "Q": [ 1008 ],
  29635. "R": [ 127 ]
  29636. }
  29637. },
  29638. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_Q_D_SB_LUT4_O": {
  29639. "hide_name": 0,
  29640. "type": "SB_LUT4",
  29641. "parameters": {
  29642. "LUT_INIT": "0000000000001100"
  29643. },
  29644. "attributes": {
  29645. "module_not_derived": "00000000000000000000000000000001",
  29646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  29647. },
  29648. "port_directions": {
  29649. "I0": "input",
  29650. "I1": "input",
  29651. "I2": "input",
  29652. "I3": "input",
  29653. "O": "output"
  29654. },
  29655. "connections": {
  29656. "I0": [ "0" ],
  29657. "I1": [ 1022 ],
  29658. "I2": [ 1018 ],
  29659. "I3": [ 1023 ],
  29660. "O": [ 1021 ]
  29661. }
  29662. },
  29663. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_LUT4_I1": {
  29664. "hide_name": 0,
  29665. "type": "SB_LUT4",
  29666. "parameters": {
  29667. "LUT_INIT": "0000001100000000"
  29668. },
  29669. "attributes": {
  29670. "module_not_derived": "00000000000000000000000000000001",
  29671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  29672. },
  29673. "port_directions": {
  29674. "I0": "input",
  29675. "I1": "input",
  29676. "I2": "input",
  29677. "I3": "input",
  29678. "O": "output"
  29679. },
  29680. "connections": {
  29681. "I0": [ "0" ],
  29682. "I1": [ 1008 ],
  29683. "I2": [ 1022 ],
  29684. "I3": [ 1024 ],
  29685. "O": [ 1025 ]
  29686. }
  29687. },
  29688. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_LUT4_I3": {
  29689. "hide_name": 0,
  29690. "type": "SB_LUT4",
  29691. "parameters": {
  29692. "LUT_INIT": "0000000011111111"
  29693. },
  29694. "attributes": {
  29695. "module_not_derived": "00000000000000000000000000000001",
  29696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  29697. },
  29698. "port_directions": {
  29699. "I0": "input",
  29700. "I1": "input",
  29701. "I2": "input",
  29702. "I3": "input",
  29703. "O": "output"
  29704. },
  29705. "connections": {
  29706. "I0": [ "0" ],
  29707. "I1": [ "0" ],
  29708. "I2": [ "0" ],
  29709. "I3": [ 1008 ],
  29710. "O": [ 1026 ]
  29711. }
  29712. },
  29713. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_DFF_Q": {
  29714. "hide_name": 0,
  29715. "type": "SB_DFF",
  29716. "parameters": {
  29717. },
  29718. "attributes": {
  29719. "module_not_derived": "00000000000000000000000000000001",
  29720. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  29721. },
  29722. "port_directions": {
  29723. "C": "input",
  29724. "D": "input",
  29725. "Q": "output"
  29726. },
  29727. "connections": {
  29728. "C": [ 42 ],
  29729. "D": [ 1027 ],
  29730. "Q": [ 1028 ]
  29731. }
  29732. },
  29733. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0": {
  29734. "hide_name": 0,
  29735. "type": "SB_LUT4",
  29736. "parameters": {
  29737. "LUT_INIT": "0000011100000000"
  29738. },
  29739. "attributes": {
  29740. "module_not_derived": "00000000000000000000000000000001",
  29741. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  29742. },
  29743. "port_directions": {
  29744. "I0": "input",
  29745. "I1": "input",
  29746. "I2": "input",
  29747. "I3": "input",
  29748. "O": "output"
  29749. },
  29750. "connections": {
  29751. "I0": [ 1028 ],
  29752. "I1": [ 1029 ],
  29753. "I2": [ 1030 ],
  29754. "I3": [ 1031 ],
  29755. "O": [ 1032 ]
  29756. }
  29757. },
  29758. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_I2_SB_LUT4_O": {
  29759. "hide_name": 0,
  29760. "type": "SB_LUT4",
  29761. "parameters": {
  29762. "LUT_INIT": "0000011101110111"
  29763. },
  29764. "attributes": {
  29765. "module_not_derived": "00000000000000000000000000000001",
  29766. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  29767. },
  29768. "port_directions": {
  29769. "I0": "input",
  29770. "I1": "input",
  29771. "I2": "input",
  29772. "I3": "input",
  29773. "O": "output"
  29774. },
  29775. "connections": {
  29776. "I0": [ 1033 ],
  29777. "I1": [ 1034 ],
  29778. "I2": [ 1035 ],
  29779. "I3": [ 1036 ],
  29780. "O": [ 1031 ]
  29781. }
  29782. },
  29783. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_I2_SB_LUT4_O_1": {
  29784. "hide_name": 0,
  29785. "type": "SB_LUT4",
  29786. "parameters": {
  29787. "LUT_INIT": "1111000000000000"
  29788. },
  29789. "attributes": {
  29790. "module_not_derived": "00000000000000000000000000000001",
  29791. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  29792. },
  29793. "port_directions": {
  29794. "I0": "input",
  29795. "I1": "input",
  29796. "I2": "input",
  29797. "I3": "input",
  29798. "O": "output"
  29799. },
  29800. "connections": {
  29801. "I0": [ "0" ],
  29802. "I1": [ "0" ],
  29803. "I2": [ 1037 ],
  29804. "I3": [ 1038 ],
  29805. "O": [ 1030 ]
  29806. }
  29807. },
  29808. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_I2_SB_LUT4_O_1_I3_SB_DFFER_Q": {
  29809. "hide_name": 0,
  29810. "type": "SB_DFFER",
  29811. "parameters": {
  29812. },
  29813. "attributes": {
  29814. "module_not_derived": "00000000000000000000000000000001",
  29815. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  29816. },
  29817. "port_directions": {
  29818. "C": "input",
  29819. "D": "input",
  29820. "E": "input",
  29821. "Q": "output",
  29822. "R": "input"
  29823. },
  29824. "connections": {
  29825. "C": [ 42 ],
  29826. "D": [ 1039 ],
  29827. "E": [ 1040 ],
  29828. "Q": [ 1038 ],
  29829. "R": [ 127 ]
  29830. }
  29831. },
  29832. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O": {
  29833. "hide_name": 0,
  29834. "type": "SB_LUT4",
  29835. "parameters": {
  29836. "LUT_INIT": "0001001101011111"
  29837. },
  29838. "attributes": {
  29839. "module_not_derived": "00000000000000000000000000000001",
  29840. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  29841. },
  29842. "port_directions": {
  29843. "I0": "input",
  29844. "I1": "input",
  29845. "I2": "input",
  29846. "I3": "input",
  29847. "O": "output"
  29848. },
  29849. "connections": {
  29850. "I0": [ 1041 ],
  29851. "I1": [ 1042 ],
  29852. "I2": [ 1043 ],
  29853. "I3": [ 1044 ],
  29854. "O": [ 1045 ]
  29855. }
  29856. },
  29857. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_DFFR_Q": {
  29858. "hide_name": 0,
  29859. "type": "SB_DFFR",
  29860. "parameters": {
  29861. },
  29862. "attributes": {
  29863. "module_not_derived": "00000000000000000000000000000001",
  29864. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  29865. },
  29866. "port_directions": {
  29867. "C": "input",
  29868. "D": "input",
  29869. "Q": "output",
  29870. "R": "input"
  29871. },
  29872. "connections": {
  29873. "C": [ 42 ],
  29874. "D": [ 1046 ],
  29875. "Q": [ 1044 ],
  29876. "R": [ 127 ]
  29877. }
  29878. },
  29879. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_DFFR_Q_D_SB_LUT4_O": {
  29880. "hide_name": 0,
  29881. "type": "SB_LUT4",
  29882. "parameters": {
  29883. "LUT_INIT": "1100111100000011"
  29884. },
  29885. "attributes": {
  29886. "module_not_derived": "00000000000000000000000000000001",
  29887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  29888. },
  29889. "port_directions": {
  29890. "I0": "input",
  29891. "I1": "input",
  29892. "I2": "input",
  29893. "I3": "input",
  29894. "O": "output"
  29895. },
  29896. "connections": {
  29897. "I0": [ "0" ],
  29898. "I1": [ 1047 ],
  29899. "I2": [ 1048 ],
  29900. "I3": [ 1039 ],
  29901. "O": [ 1046 ]
  29902. }
  29903. },
  29904. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_DFFR_Q_D_SB_LUT4_O_I2_SB_LUT4_O": {
  29905. "hide_name": 0,
  29906. "type": "SB_LUT4",
  29907. "parameters": {
  29908. "LUT_INIT": "0101110001011111"
  29909. },
  29910. "attributes": {
  29911. "module_not_derived": "00000000000000000000000000000001",
  29912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  29913. },
  29914. "port_directions": {
  29915. "I0": "input",
  29916. "I1": "input",
  29917. "I2": "input",
  29918. "I3": "input",
  29919. "O": "output"
  29920. },
  29921. "connections": {
  29922. "I0": [ 1049 ],
  29923. "I1": [ 1009 ],
  29924. "I2": [ 1050 ],
  29925. "I3": [ 1051 ],
  29926. "O": [ 1048 ]
  29927. }
  29928. },
  29929. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I1": {
  29930. "hide_name": 0,
  29931. "type": "SB_LUT4",
  29932. "parameters": {
  29933. "LUT_INIT": "0000111100110011"
  29934. },
  29935. "attributes": {
  29936. "module_not_derived": "00000000000000000000000000000001",
  29937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  29938. },
  29939. "port_directions": {
  29940. "I0": "input",
  29941. "I1": "input",
  29942. "I2": "input",
  29943. "I3": "input",
  29944. "O": "output"
  29945. },
  29946. "connections": {
  29947. "I0": [ "0" ],
  29948. "I1": [ 1044 ],
  29949. "I2": [ 1049 ],
  29950. "I3": [ 1052 ],
  29951. "O": [ 1053 ]
  29952. }
  29953. },
  29954. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I1_O_SB_LUT4_I3": {
  29955. "hide_name": 0,
  29956. "type": "SB_LUT4",
  29957. "parameters": {
  29958. "LUT_INIT": "1110001011110011"
  29959. },
  29960. "attributes": {
  29961. "module_not_derived": "00000000000000000000000000000001",
  29962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  29963. },
  29964. "port_directions": {
  29965. "I0": "input",
  29966. "I1": "input",
  29967. "I2": "input",
  29968. "I3": "input",
  29969. "O": "output"
  29970. },
  29971. "connections": {
  29972. "I0": [ 1050 ],
  29973. "I1": [ 1047 ],
  29974. "I2": [ 1054 ],
  29975. "I3": [ 1053 ],
  29976. "O": [ 1055 ]
  29977. }
  29978. },
  29979. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I2": {
  29980. "hide_name": 0,
  29981. "type": "SB_LUT4",
  29982. "parameters": {
  29983. "LUT_INIT": "0000000011110000"
  29984. },
  29985. "attributes": {
  29986. "module_not_derived": "00000000000000000000000000000001",
  29987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  29988. },
  29989. "port_directions": {
  29990. "I0": "input",
  29991. "I1": "input",
  29992. "I2": "input",
  29993. "I3": "input",
  29994. "O": "output"
  29995. },
  29996. "connections": {
  29997. "I0": [ "0" ],
  29998. "I1": [ "0" ],
  29999. "I2": [ 1044 ],
  30000. "I3": [ 1025 ],
  30001. "O": [ 1051 ]
  30002. }
  30003. },
  30004. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_DFFR_Q": {
  30005. "hide_name": 0,
  30006. "type": "SB_DFFR",
  30007. "parameters": {
  30008. },
  30009. "attributes": {
  30010. "module_not_derived": "00000000000000000000000000000001",
  30011. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  30012. },
  30013. "port_directions": {
  30014. "C": "input",
  30015. "D": "input",
  30016. "Q": "output",
  30017. "R": "input"
  30018. },
  30019. "connections": {
  30020. "C": [ 42 ],
  30021. "D": [ 1055 ],
  30022. "Q": [ 1049 ],
  30023. "R": [ 127 ]
  30024. }
  30025. },
  30026. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I1": {
  30027. "hide_name": 0,
  30028. "type": "SB_LUT4",
  30029. "parameters": {
  30030. "LUT_INIT": "0000000011111100"
  30031. },
  30032. "attributes": {
  30033. "module_not_derived": "00000000000000000000000000000001",
  30034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  30035. },
  30036. "port_directions": {
  30037. "I0": "input",
  30038. "I1": "input",
  30039. "I2": "input",
  30040. "I3": "input",
  30041. "O": "output"
  30042. },
  30043. "connections": {
  30044. "I0": [ "0" ],
  30045. "I1": [ 1028 ],
  30046. "I2": [ 1009 ],
  30047. "I3": [ 1025 ],
  30048. "O": [ 1027 ]
  30049. }
  30050. },
  30051. "cpu_I.CsrPlugin_mcause_interrupt_SB_DFF_Q": {
  30052. "hide_name": 0,
  30053. "type": "SB_DFF",
  30054. "parameters": {
  30055. },
  30056. "attributes": {
  30057. "module_not_derived": "00000000000000000000000000000001",
  30058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30059. },
  30060. "port_directions": {
  30061. "C": "input",
  30062. "D": "input",
  30063. "Q": "output"
  30064. },
  30065. "connections": {
  30066. "C": [ 42 ],
  30067. "D": [ 1056 ],
  30068. "Q": [ 1057 ]
  30069. }
  30070. },
  30071. "cpu_I.CsrPlugin_mcause_interrupt_SB_LUT4_I1": {
  30072. "hide_name": 0,
  30073. "type": "SB_LUT4",
  30074. "parameters": {
  30075. "LUT_INIT": "1111111100001100"
  30076. },
  30077. "attributes": {
  30078. "module_not_derived": "00000000000000000000000000000001",
  30079. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  30080. },
  30081. "port_directions": {
  30082. "I0": "input",
  30083. "I1": "input",
  30084. "I2": "input",
  30085. "I3": "input",
  30086. "O": "output"
  30087. },
  30088. "connections": {
  30089. "I0": [ "0" ],
  30090. "I1": [ 1057 ],
  30091. "I2": [ 1009 ],
  30092. "I3": [ 1025 ],
  30093. "O": [ 1056 ]
  30094. }
  30095. },
  30096. "cpu_I.CsrPlugin_mcause_interrupt_SB_LUT4_I2": {
  30097. "hide_name": 0,
  30098. "type": "SB_LUT4",
  30099. "parameters": {
  30100. "LUT_INIT": "1111000000000000"
  30101. },
  30102. "attributes": {
  30103. "module_not_derived": "00000000000000000000000000000001",
  30104. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  30105. },
  30106. "port_directions": {
  30107. "I0": "input",
  30108. "I1": "input",
  30109. "I2": "input",
  30110. "I3": "input",
  30111. "O": "output"
  30112. },
  30113. "connections": {
  30114. "I0": [ "0" ],
  30115. "I1": [ "0" ],
  30116. "I2": [ 1057 ],
  30117. "I3": [ 1029 ],
  30118. "O": [ 1058 ]
  30119. }
  30120. },
  30121. "cpu_I.CsrPlugin_mcause_interrupt_SB_LUT4_I2_O_SB_DFFER_Q": {
  30122. "hide_name": 0,
  30123. "type": "SB_DFFER",
  30124. "parameters": {
  30125. },
  30126. "attributes": {
  30127. "module_not_derived": "00000000000000000000000000000001",
  30128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  30129. },
  30130. "port_directions": {
  30131. "C": "input",
  30132. "D": "input",
  30133. "E": "input",
  30134. "Q": "output",
  30135. "R": "input"
  30136. },
  30137. "connections": {
  30138. "C": [ 42 ],
  30139. "D": [ 1059 ],
  30140. "E": [ 1040 ],
  30141. "Q": [ 1060 ],
  30142. "R": [ 127 ]
  30143. }
  30144. },
  30145. "cpu_I.CsrPlugin_mcause_interrupt_SB_LUT4_I2_O_SB_LUT4_O": {
  30146. "hide_name": 0,
  30147. "type": "SB_LUT4",
  30148. "parameters": {
  30149. "LUT_INIT": "0001001101011111"
  30150. },
  30151. "attributes": {
  30152. "module_not_derived": "00000000000000000000000000000001",
  30153. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  30154. },
  30155. "port_directions": {
  30156. "I0": "input",
  30157. "I1": "input",
  30158. "I2": "input",
  30159. "I3": "input",
  30160. "O": "output"
  30161. },
  30162. "connections": {
  30163. "I0": [ 1061 ],
  30164. "I1": [ 1062 ],
  30165. "I2": [ 1034 ],
  30166. "I3": [ 1043 ],
  30167. "O": [ 1063 ]
  30168. }
  30169. },
  30170. "cpu_I.CsrPlugin_mepc_SB_DFF_Q": {
  30171. "hide_name": 0,
  30172. "type": "SB_DFF",
  30173. "parameters": {
  30174. },
  30175. "attributes": {
  30176. "module_not_derived": "00000000000000000000000000000001",
  30177. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30178. },
  30179. "port_directions": {
  30180. "C": "input",
  30181. "D": "input",
  30182. "Q": "output"
  30183. },
  30184. "connections": {
  30185. "C": [ 42 ],
  30186. "D": [ 1064 ],
  30187. "Q": [ 1062 ]
  30188. }
  30189. },
  30190. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_1": {
  30191. "hide_name": 0,
  30192. "type": "SB_DFF",
  30193. "parameters": {
  30194. },
  30195. "attributes": {
  30196. "module_not_derived": "00000000000000000000000000000001",
  30197. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30198. },
  30199. "port_directions": {
  30200. "C": "input",
  30201. "D": "input",
  30202. "Q": "output"
  30203. },
  30204. "connections": {
  30205. "C": [ 42 ],
  30206. "D": [ 1065 ],
  30207. "Q": [ 1066 ]
  30208. }
  30209. },
  30210. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_10": {
  30211. "hide_name": 0,
  30212. "type": "SB_DFF",
  30213. "parameters": {
  30214. },
  30215. "attributes": {
  30216. "module_not_derived": "00000000000000000000000000000001",
  30217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30218. },
  30219. "port_directions": {
  30220. "C": "input",
  30221. "D": "input",
  30222. "Q": "output"
  30223. },
  30224. "connections": {
  30225. "C": [ 42 ],
  30226. "D": [ 1067 ],
  30227. "Q": [ 1068 ]
  30228. }
  30229. },
  30230. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_11": {
  30231. "hide_name": 0,
  30232. "type": "SB_DFF",
  30233. "parameters": {
  30234. },
  30235. "attributes": {
  30236. "module_not_derived": "00000000000000000000000000000001",
  30237. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30238. },
  30239. "port_directions": {
  30240. "C": "input",
  30241. "D": "input",
  30242. "Q": "output"
  30243. },
  30244. "connections": {
  30245. "C": [ 42 ],
  30246. "D": [ 1069 ],
  30247. "Q": [ 1070 ]
  30248. }
  30249. },
  30250. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_12": {
  30251. "hide_name": 0,
  30252. "type": "SB_DFF",
  30253. "parameters": {
  30254. },
  30255. "attributes": {
  30256. "module_not_derived": "00000000000000000000000000000001",
  30257. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30258. },
  30259. "port_directions": {
  30260. "C": "input",
  30261. "D": "input",
  30262. "Q": "output"
  30263. },
  30264. "connections": {
  30265. "C": [ 42 ],
  30266. "D": [ 1071 ],
  30267. "Q": [ 1072 ]
  30268. }
  30269. },
  30270. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_13": {
  30271. "hide_name": 0,
  30272. "type": "SB_DFF",
  30273. "parameters": {
  30274. },
  30275. "attributes": {
  30276. "module_not_derived": "00000000000000000000000000000001",
  30277. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30278. },
  30279. "port_directions": {
  30280. "C": "input",
  30281. "D": "input",
  30282. "Q": "output"
  30283. },
  30284. "connections": {
  30285. "C": [ 42 ],
  30286. "D": [ 1073 ],
  30287. "Q": [ 1074 ]
  30288. }
  30289. },
  30290. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_14": {
  30291. "hide_name": 0,
  30292. "type": "SB_DFF",
  30293. "parameters": {
  30294. },
  30295. "attributes": {
  30296. "module_not_derived": "00000000000000000000000000000001",
  30297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30298. },
  30299. "port_directions": {
  30300. "C": "input",
  30301. "D": "input",
  30302. "Q": "output"
  30303. },
  30304. "connections": {
  30305. "C": [ 42 ],
  30306. "D": [ 1075 ],
  30307. "Q": [ 1076 ]
  30308. }
  30309. },
  30310. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_15": {
  30311. "hide_name": 0,
  30312. "type": "SB_DFF",
  30313. "parameters": {
  30314. },
  30315. "attributes": {
  30316. "module_not_derived": "00000000000000000000000000000001",
  30317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30318. },
  30319. "port_directions": {
  30320. "C": "input",
  30321. "D": "input",
  30322. "Q": "output"
  30323. },
  30324. "connections": {
  30325. "C": [ 42 ],
  30326. "D": [ 1077 ],
  30327. "Q": [ 1078 ]
  30328. }
  30329. },
  30330. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_16": {
  30331. "hide_name": 0,
  30332. "type": "SB_DFF",
  30333. "parameters": {
  30334. },
  30335. "attributes": {
  30336. "module_not_derived": "00000000000000000000000000000001",
  30337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30338. },
  30339. "port_directions": {
  30340. "C": "input",
  30341. "D": "input",
  30342. "Q": "output"
  30343. },
  30344. "connections": {
  30345. "C": [ 42 ],
  30346. "D": [ 1079 ],
  30347. "Q": [ 1080 ]
  30348. }
  30349. },
  30350. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_17": {
  30351. "hide_name": 0,
  30352. "type": "SB_DFF",
  30353. "parameters": {
  30354. },
  30355. "attributes": {
  30356. "module_not_derived": "00000000000000000000000000000001",
  30357. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30358. },
  30359. "port_directions": {
  30360. "C": "input",
  30361. "D": "input",
  30362. "Q": "output"
  30363. },
  30364. "connections": {
  30365. "C": [ 42 ],
  30366. "D": [ 1081 ],
  30367. "Q": [ 1082 ]
  30368. }
  30369. },
  30370. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_18": {
  30371. "hide_name": 0,
  30372. "type": "SB_DFF",
  30373. "parameters": {
  30374. },
  30375. "attributes": {
  30376. "module_not_derived": "00000000000000000000000000000001",
  30377. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30378. },
  30379. "port_directions": {
  30380. "C": "input",
  30381. "D": "input",
  30382. "Q": "output"
  30383. },
  30384. "connections": {
  30385. "C": [ 42 ],
  30386. "D": [ 1083 ],
  30387. "Q": [ 1084 ]
  30388. }
  30389. },
  30390. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_19": {
  30391. "hide_name": 0,
  30392. "type": "SB_DFF",
  30393. "parameters": {
  30394. },
  30395. "attributes": {
  30396. "module_not_derived": "00000000000000000000000000000001",
  30397. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30398. },
  30399. "port_directions": {
  30400. "C": "input",
  30401. "D": "input",
  30402. "Q": "output"
  30403. },
  30404. "connections": {
  30405. "C": [ 42 ],
  30406. "D": [ 1085 ],
  30407. "Q": [ 1086 ]
  30408. }
  30409. },
  30410. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_2": {
  30411. "hide_name": 0,
  30412. "type": "SB_DFF",
  30413. "parameters": {
  30414. },
  30415. "attributes": {
  30416. "module_not_derived": "00000000000000000000000000000001",
  30417. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30418. },
  30419. "port_directions": {
  30420. "C": "input",
  30421. "D": "input",
  30422. "Q": "output"
  30423. },
  30424. "connections": {
  30425. "C": [ 42 ],
  30426. "D": [ 1087 ],
  30427. "Q": [ 1088 ]
  30428. }
  30429. },
  30430. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_20": {
  30431. "hide_name": 0,
  30432. "type": "SB_DFF",
  30433. "parameters": {
  30434. },
  30435. "attributes": {
  30436. "module_not_derived": "00000000000000000000000000000001",
  30437. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30438. },
  30439. "port_directions": {
  30440. "C": "input",
  30441. "D": "input",
  30442. "Q": "output"
  30443. },
  30444. "connections": {
  30445. "C": [ 42 ],
  30446. "D": [ 1089 ],
  30447. "Q": [ 1090 ]
  30448. }
  30449. },
  30450. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_21": {
  30451. "hide_name": 0,
  30452. "type": "SB_DFF",
  30453. "parameters": {
  30454. },
  30455. "attributes": {
  30456. "module_not_derived": "00000000000000000000000000000001",
  30457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30458. },
  30459. "port_directions": {
  30460. "C": "input",
  30461. "D": "input",
  30462. "Q": "output"
  30463. },
  30464. "connections": {
  30465. "C": [ 42 ],
  30466. "D": [ 1091 ],
  30467. "Q": [ 1092 ]
  30468. }
  30469. },
  30470. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_22": {
  30471. "hide_name": 0,
  30472. "type": "SB_DFF",
  30473. "parameters": {
  30474. },
  30475. "attributes": {
  30476. "module_not_derived": "00000000000000000000000000000001",
  30477. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30478. },
  30479. "port_directions": {
  30480. "C": "input",
  30481. "D": "input",
  30482. "Q": "output"
  30483. },
  30484. "connections": {
  30485. "C": [ 42 ],
  30486. "D": [ 1093 ],
  30487. "Q": [ 1094 ]
  30488. }
  30489. },
  30490. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_23": {
  30491. "hide_name": 0,
  30492. "type": "SB_DFF",
  30493. "parameters": {
  30494. },
  30495. "attributes": {
  30496. "module_not_derived": "00000000000000000000000000000001",
  30497. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30498. },
  30499. "port_directions": {
  30500. "C": "input",
  30501. "D": "input",
  30502. "Q": "output"
  30503. },
  30504. "connections": {
  30505. "C": [ 42 ],
  30506. "D": [ 1095 ],
  30507. "Q": [ 1096 ]
  30508. }
  30509. },
  30510. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_24": {
  30511. "hide_name": 0,
  30512. "type": "SB_DFF",
  30513. "parameters": {
  30514. },
  30515. "attributes": {
  30516. "module_not_derived": "00000000000000000000000000000001",
  30517. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30518. },
  30519. "port_directions": {
  30520. "C": "input",
  30521. "D": "input",
  30522. "Q": "output"
  30523. },
  30524. "connections": {
  30525. "C": [ 42 ],
  30526. "D": [ 1097 ],
  30527. "Q": [ 1098 ]
  30528. }
  30529. },
  30530. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_25": {
  30531. "hide_name": 0,
  30532. "type": "SB_DFF",
  30533. "parameters": {
  30534. },
  30535. "attributes": {
  30536. "module_not_derived": "00000000000000000000000000000001",
  30537. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30538. },
  30539. "port_directions": {
  30540. "C": "input",
  30541. "D": "input",
  30542. "Q": "output"
  30543. },
  30544. "connections": {
  30545. "C": [ 42 ],
  30546. "D": [ 1099 ],
  30547. "Q": [ 1100 ]
  30548. }
  30549. },
  30550. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_26": {
  30551. "hide_name": 0,
  30552. "type": "SB_DFF",
  30553. "parameters": {
  30554. },
  30555. "attributes": {
  30556. "module_not_derived": "00000000000000000000000000000001",
  30557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30558. },
  30559. "port_directions": {
  30560. "C": "input",
  30561. "D": "input",
  30562. "Q": "output"
  30563. },
  30564. "connections": {
  30565. "C": [ 42 ],
  30566. "D": [ 1101 ],
  30567. "Q": [ 1102 ]
  30568. }
  30569. },
  30570. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_27": {
  30571. "hide_name": 0,
  30572. "type": "SB_DFF",
  30573. "parameters": {
  30574. },
  30575. "attributes": {
  30576. "module_not_derived": "00000000000000000000000000000001",
  30577. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30578. },
  30579. "port_directions": {
  30580. "C": "input",
  30581. "D": "input",
  30582. "Q": "output"
  30583. },
  30584. "connections": {
  30585. "C": [ 42 ],
  30586. "D": [ 1103 ],
  30587. "Q": [ 1104 ]
  30588. }
  30589. },
  30590. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_28": {
  30591. "hide_name": 0,
  30592. "type": "SB_DFF",
  30593. "parameters": {
  30594. },
  30595. "attributes": {
  30596. "module_not_derived": "00000000000000000000000000000001",
  30597. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30598. },
  30599. "port_directions": {
  30600. "C": "input",
  30601. "D": "input",
  30602. "Q": "output"
  30603. },
  30604. "connections": {
  30605. "C": [ 42 ],
  30606. "D": [ 1105 ],
  30607. "Q": [ 1041 ]
  30608. }
  30609. },
  30610. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_29": {
  30611. "hide_name": 0,
  30612. "type": "SB_DFF",
  30613. "parameters": {
  30614. },
  30615. "attributes": {
  30616. "module_not_derived": "00000000000000000000000000000001",
  30617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30618. },
  30619. "port_directions": {
  30620. "C": "input",
  30621. "D": "input",
  30622. "Q": "output"
  30623. },
  30624. "connections": {
  30625. "C": [ 42 ],
  30626. "D": [ 1106 ],
  30627. "Q": [ 1107 ]
  30628. }
  30629. },
  30630. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_3": {
  30631. "hide_name": 0,
  30632. "type": "SB_DFF",
  30633. "parameters": {
  30634. },
  30635. "attributes": {
  30636. "module_not_derived": "00000000000000000000000000000001",
  30637. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30638. },
  30639. "port_directions": {
  30640. "C": "input",
  30641. "D": "input",
  30642. "Q": "output"
  30643. },
  30644. "connections": {
  30645. "C": [ 42 ],
  30646. "D": [ 1108 ],
  30647. "Q": [ 1109 ]
  30648. }
  30649. },
  30650. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_30": {
  30651. "hide_name": 0,
  30652. "type": "SB_DFF",
  30653. "parameters": {
  30654. },
  30655. "attributes": {
  30656. "module_not_derived": "00000000000000000000000000000001",
  30657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30658. },
  30659. "port_directions": {
  30660. "C": "input",
  30661. "D": "input",
  30662. "Q": "output"
  30663. },
  30664. "connections": {
  30665. "C": [ 42 ],
  30666. "D": [ 1110 ],
  30667. "Q": [ 1111 ]
  30668. }
  30669. },
  30670. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_31": {
  30671. "hide_name": 0,
  30672. "type": "SB_DFF",
  30673. "parameters": {
  30674. },
  30675. "attributes": {
  30676. "module_not_derived": "00000000000000000000000000000001",
  30677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30678. },
  30679. "port_directions": {
  30680. "C": "input",
  30681. "D": "input",
  30682. "Q": "output"
  30683. },
  30684. "connections": {
  30685. "C": [ 42 ],
  30686. "D": [ 1112 ],
  30687. "Q": [ 1113 ]
  30688. }
  30689. },
  30690. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_4": {
  30691. "hide_name": 0,
  30692. "type": "SB_DFF",
  30693. "parameters": {
  30694. },
  30695. "attributes": {
  30696. "module_not_derived": "00000000000000000000000000000001",
  30697. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30698. },
  30699. "port_directions": {
  30700. "C": "input",
  30701. "D": "input",
  30702. "Q": "output"
  30703. },
  30704. "connections": {
  30705. "C": [ 42 ],
  30706. "D": [ 1114 ],
  30707. "Q": [ 1115 ]
  30708. }
  30709. },
  30710. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_5": {
  30711. "hide_name": 0,
  30712. "type": "SB_DFF",
  30713. "parameters": {
  30714. },
  30715. "attributes": {
  30716. "module_not_derived": "00000000000000000000000000000001",
  30717. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30718. },
  30719. "port_directions": {
  30720. "C": "input",
  30721. "D": "input",
  30722. "Q": "output"
  30723. },
  30724. "connections": {
  30725. "C": [ 42 ],
  30726. "D": [ 1116 ],
  30727. "Q": [ 1117 ]
  30728. }
  30729. },
  30730. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_6": {
  30731. "hide_name": 0,
  30732. "type": "SB_DFF",
  30733. "parameters": {
  30734. },
  30735. "attributes": {
  30736. "module_not_derived": "00000000000000000000000000000001",
  30737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30738. },
  30739. "port_directions": {
  30740. "C": "input",
  30741. "D": "input",
  30742. "Q": "output"
  30743. },
  30744. "connections": {
  30745. "C": [ 42 ],
  30746. "D": [ 1118 ],
  30747. "Q": [ 1119 ]
  30748. }
  30749. },
  30750. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_7": {
  30751. "hide_name": 0,
  30752. "type": "SB_DFF",
  30753. "parameters": {
  30754. },
  30755. "attributes": {
  30756. "module_not_derived": "00000000000000000000000000000001",
  30757. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30758. },
  30759. "port_directions": {
  30760. "C": "input",
  30761. "D": "input",
  30762. "Q": "output"
  30763. },
  30764. "connections": {
  30765. "C": [ 42 ],
  30766. "D": [ 1120 ],
  30767. "Q": [ 1121 ]
  30768. }
  30769. },
  30770. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_8": {
  30771. "hide_name": 0,
  30772. "type": "SB_DFF",
  30773. "parameters": {
  30774. },
  30775. "attributes": {
  30776. "module_not_derived": "00000000000000000000000000000001",
  30777. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30778. },
  30779. "port_directions": {
  30780. "C": "input",
  30781. "D": "input",
  30782. "Q": "output"
  30783. },
  30784. "connections": {
  30785. "C": [ 42 ],
  30786. "D": [ 1122 ],
  30787. "Q": [ 1123 ]
  30788. }
  30789. },
  30790. "cpu_I.CsrPlugin_mepc_SB_DFF_Q_9": {
  30791. "hide_name": 0,
  30792. "type": "SB_DFF",
  30793. "parameters": {
  30794. },
  30795. "attributes": {
  30796. "module_not_derived": "00000000000000000000000000000001",
  30797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  30798. },
  30799. "port_directions": {
  30800. "C": "input",
  30801. "D": "input",
  30802. "Q": "output"
  30803. },
  30804. "connections": {
  30805. "C": [ 42 ],
  30806. "D": [ 1124 ],
  30807. "Q": [ 1125 ]
  30808. }
  30809. },
  30810. "cpu_I.CsrPlugin_mip_MSIP_SB_DFFSR_Q": {
  30811. "hide_name": 0,
  30812. "type": "SB_DFFSR",
  30813. "parameters": {
  30814. },
  30815. "attributes": {
  30816. "module_not_derived": "00000000000000000000000000000001",
  30817. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  30818. },
  30819. "port_directions": {
  30820. "C": "input",
  30821. "D": "input",
  30822. "Q": "output",
  30823. "R": "input"
  30824. },
  30825. "connections": {
  30826. "C": [ 42 ],
  30827. "D": [ 1039 ],
  30828. "Q": [ 1126 ],
  30829. "R": [ 1127 ]
  30830. }
  30831. },
  30832. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I0": {
  30833. "hide_name": 0,
  30834. "type": "SB_LUT4",
  30835. "parameters": {
  30836. "LUT_INIT": "0111000000000000"
  30837. },
  30838. "attributes": {
  30839. "module_not_derived": "00000000000000000000000000000001",
  30840. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  30841. },
  30842. "port_directions": {
  30843. "I0": "input",
  30844. "I1": "input",
  30845. "I2": "input",
  30846. "I3": "input",
  30847. "O": "output"
  30848. },
  30849. "connections": {
  30850. "I0": [ 1126 ],
  30851. "I1": [ 1128 ],
  30852. "I2": [ 1045 ],
  30853. "I3": [ 1032 ],
  30854. "O": [ 1129 ]
  30855. }
  30856. },
  30857. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1": {
  30858. "hide_name": 0,
  30859. "type": "SB_LUT4",
  30860. "parameters": {
  30861. "LUT_INIT": "1100000000000000"
  30862. },
  30863. "attributes": {
  30864. "module_not_derived": "00000000000000000000000000000001",
  30865. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  30866. },
  30867. "port_directions": {
  30868. "I0": "input",
  30869. "I1": "input",
  30870. "I2": "input",
  30871. "I3": "input",
  30872. "O": "output"
  30873. },
  30874. "connections": {
  30875. "I0": [ "0" ],
  30876. "I1": [ 1126 ],
  30877. "I2": [ 1036 ],
  30878. "I3": [ 1051 ],
  30879. "O": [ 1130 ]
  30880. }
  30881. },
  30882. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_DFFR_Q": {
  30883. "hide_name": 0,
  30884. "type": "SB_DFFR",
  30885. "parameters": {
  30886. },
  30887. "attributes": {
  30888. "module_not_derived": "00000000000000000000000000000001",
  30889. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  30890. },
  30891. "port_directions": {
  30892. "C": "input",
  30893. "D": "input",
  30894. "Q": "output",
  30895. "R": "input"
  30896. },
  30897. "connections": {
  30898. "C": [ 42 ],
  30899. "D": [ 1131 ],
  30900. "Q": [ 1036 ],
  30901. "R": [ 127 ]
  30902. }
  30903. },
  30904. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1": {
  30905. "hide_name": 0,
  30906. "type": "SB_LUT4",
  30907. "parameters": {
  30908. "LUT_INIT": "1111110000001100"
  30909. },
  30910. "attributes": {
  30911. "module_not_derived": "00000000000000000000000000000001",
  30912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  30913. },
  30914. "port_directions": {
  30915. "I0": "input",
  30916. "I1": "input",
  30917. "I2": "input",
  30918. "I3": "input",
  30919. "O": "output"
  30920. },
  30921. "connections": {
  30922. "I0": [ "0" ],
  30923. "I1": [ 1036 ],
  30924. "I2": [ 1132 ],
  30925. "I3": [ 1039 ],
  30926. "O": [ 1131 ]
  30927. }
  30928. },
  30929. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2": {
  30930. "hide_name": 0,
  30931. "type": "SB_LUT4",
  30932. "parameters": {
  30933. "LUT_INIT": "1111110000001100"
  30934. },
  30935. "attributes": {
  30936. "module_not_derived": "00000000000000000000000000000001",
  30937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  30938. },
  30939. "port_directions": {
  30940. "I0": "input",
  30941. "I1": "input",
  30942. "I2": "input",
  30943. "I3": "input",
  30944. "O": "output"
  30945. },
  30946. "connections": {
  30947. "I0": [ "0" ],
  30948. "I1": [ 1133 ],
  30949. "I2": [ 1132 ],
  30950. "I3": [ 1054 ],
  30951. "O": [ 1134 ]
  30952. }
  30953. },
  30954. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1": {
  30955. "hide_name": 0,
  30956. "type": "SB_LUT4",
  30957. "parameters": {
  30958. "LUT_INIT": "1111110000001100"
  30959. },
  30960. "attributes": {
  30961. "module_not_derived": "00000000000000000000000000000001",
  30962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  30963. },
  30964. "port_directions": {
  30965. "I0": "input",
  30966. "I1": "input",
  30967. "I2": "input",
  30968. "I3": "input",
  30969. "O": "output"
  30970. },
  30971. "connections": {
  30972. "I0": [ "0" ],
  30973. "I1": [ 1135 ],
  30974. "I2": [ 1132 ],
  30975. "I3": [ 1136 ],
  30976. "O": [ 1137 ]
  30977. }
  30978. },
  30979. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3": {
  30980. "hide_name": 0,
  30981. "type": "SB_LUT4",
  30982. "parameters": {
  30983. "LUT_INIT": "0001001101011111"
  30984. },
  30985. "attributes": {
  30986. "module_not_derived": "00000000000000000000000000000001",
  30987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  30988. },
  30989. "port_directions": {
  30990. "I0": "input",
  30991. "I1": "input",
  30992. "I2": "input",
  30993. "I3": "input",
  30994. "O": "output"
  30995. },
  30996. "connections": {
  30997. "I0": [ 1090 ],
  30998. "I1": [ 1035 ],
  30999. "I2": [ 1043 ],
  31000. "I3": [ 1135 ],
  31001. "O": [ 1138 ]
  31002. }
  31003. },
  31004. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_DFFER_Q": {
  31005. "hide_name": 0,
  31006. "type": "SB_DFFER",
  31007. "parameters": {
  31008. },
  31009. "attributes": {
  31010. "module_not_derived": "00000000000000000000000000000001",
  31011. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  31012. },
  31013. "port_directions": {
  31014. "C": "input",
  31015. "D": "input",
  31016. "E": "input",
  31017. "Q": "output",
  31018. "R": "input"
  31019. },
  31020. "connections": {
  31021. "C": [ 42 ],
  31022. "D": [ 1136 ],
  31023. "E": [ 1040 ],
  31024. "Q": [ 1139 ],
  31025. "R": [ 127 ]
  31026. }
  31027. },
  31028. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O": {
  31029. "hide_name": 0,
  31030. "type": "SB_LUT4",
  31031. "parameters": {
  31032. "LUT_INIT": "0001001101011111"
  31033. },
  31034. "attributes": {
  31035. "module_not_derived": "00000000000000000000000000000001",
  31036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  31037. },
  31038. "port_directions": {
  31039. "I0": "input",
  31040. "I1": "input",
  31041. "I2": "input",
  31042. "I3": "input",
  31043. "O": "output"
  31044. },
  31045. "connections": {
  31046. "I0": [ 1140 ],
  31047. "I1": [ 1042 ],
  31048. "I2": [ 1034 ],
  31049. "I3": [ 1141 ],
  31050. "O": [ 1142 ]
  31051. }
  31052. },
  31053. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q": {
  31054. "hide_name": 0,
  31055. "type": "SB_DFFS",
  31056. "parameters": {
  31057. },
  31058. "attributes": {
  31059. "module_not_derived": "00000000000000000000000000000001",
  31060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  31061. },
  31062. "port_directions": {
  31063. "C": "input",
  31064. "D": "input",
  31065. "Q": "output",
  31066. "S": "input"
  31067. },
  31068. "connections": {
  31069. "C": [ 42 ],
  31070. "D": [ 1143 ],
  31071. "Q": [ 1141 ],
  31072. "S": [ 127 ]
  31073. }
  31074. },
  31075. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q_D_SB_DFFS_D": {
  31076. "hide_name": 0,
  31077. "type": "SB_DFFS",
  31078. "parameters": {
  31079. },
  31080. "attributes": {
  31081. "module_not_derived": "00000000000000000000000000000001",
  31082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  31083. },
  31084. "port_directions": {
  31085. "C": "input",
  31086. "D": "input",
  31087. "Q": "output",
  31088. "S": "input"
  31089. },
  31090. "connections": {
  31091. "C": [ 42 ],
  31092. "D": [ 1144 ],
  31093. "Q": [ 1145 ],
  31094. "S": [ 127 ]
  31095. }
  31096. },
  31097. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q_D_SB_DFFS_D_Q_SB_LUT4_O": {
  31098. "hide_name": 0,
  31099. "type": "SB_LUT4",
  31100. "parameters": {
  31101. "LUT_INIT": "0000000000001111"
  31102. },
  31103. "attributes": {
  31104. "module_not_derived": "00000000000000000000000000000001",
  31105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  31106. },
  31107. "port_directions": {
  31108. "I0": "input",
  31109. "I1": "input",
  31110. "I2": "input",
  31111. "I3": "input",
  31112. "O": "output"
  31113. },
  31114. "connections": {
  31115. "I0": [ "0" ],
  31116. "I1": [ "0" ],
  31117. "I2": [ 1009 ],
  31118. "I3": [ 1025 ],
  31119. "O": [ 1052 ]
  31120. }
  31121. },
  31122. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q_D_SB_LUT4_O": {
  31123. "hide_name": 0,
  31124. "type": "SB_LUT4",
  31125. "parameters": {
  31126. "LUT_INIT": "1100000011010001"
  31127. },
  31128. "attributes": {
  31129. "module_not_derived": "00000000000000000000000000000001",
  31130. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  31131. },
  31132. "port_directions": {
  31133. "I0": "input",
  31134. "I1": "input",
  31135. "I2": "input",
  31136. "I3": "input",
  31137. "O": "output"
  31138. },
  31139. "connections": {
  31140. "I0": [ 1050 ],
  31141. "I1": [ 1047 ],
  31142. "I2": [ 1146 ],
  31143. "I3": [ 1147 ],
  31144. "O": [ 1144 ]
  31145. }
  31146. },
  31147. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q_D_SB_LUT4_O_1": {
  31148. "hide_name": 0,
  31149. "type": "SB_LUT4",
  31150. "parameters": {
  31151. "LUT_INIT": "1100000011010001"
  31152. },
  31153. "attributes": {
  31154. "module_not_derived": "00000000000000000000000000000001",
  31155. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  31156. },
  31157. "port_directions": {
  31158. "I0": "input",
  31159. "I1": "input",
  31160. "I2": "input",
  31161. "I3": "input",
  31162. "O": "output"
  31163. },
  31164. "connections": {
  31165. "I0": [ 1050 ],
  31166. "I1": [ 1047 ],
  31167. "I2": [ 1136 ],
  31168. "I3": [ 1148 ],
  31169. "O": [ 1143 ]
  31170. }
  31171. },
  31172. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2": {
  31173. "hide_name": 0,
  31174. "type": "SB_LUT4",
  31175. "parameters": {
  31176. "LUT_INIT": "0000111100000000"
  31177. },
  31178. "attributes": {
  31179. "module_not_derived": "00000000000000000000000000000001",
  31180. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  31181. },
  31182. "port_directions": {
  31183. "I0": "input",
  31184. "I1": "input",
  31185. "I2": "input",
  31186. "I3": "input",
  31187. "O": "output"
  31188. },
  31189. "connections": {
  31190. "I0": [ "0" ],
  31191. "I1": [ "0" ],
  31192. "I2": [ 1141 ],
  31193. "I3": [ 1052 ],
  31194. "O": [ 1148 ]
  31195. }
  31196. },
  31197. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_O_SB_DFFR_D": {
  31198. "hide_name": 0,
  31199. "type": "SB_DFFR",
  31200. "parameters": {
  31201. },
  31202. "attributes": {
  31203. "module_not_derived": "00000000000000000000000000000001",
  31204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  31205. },
  31206. "port_directions": {
  31207. "C": "input",
  31208. "D": "input",
  31209. "Q": "output",
  31210. "R": "input"
  31211. },
  31212. "connections": {
  31213. "C": [ 42 ],
  31214. "D": [ 1137 ],
  31215. "Q": [ 1135 ],
  31216. "R": [ 127 ]
  31217. }
  31218. },
  31219. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O_SB_DFFR_D": {
  31220. "hide_name": 0,
  31221. "type": "SB_DFFR",
  31222. "parameters": {
  31223. },
  31224. "attributes": {
  31225. "module_not_derived": "00000000000000000000000000000001",
  31226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  31227. },
  31228. "port_directions": {
  31229. "C": "input",
  31230. "D": "input",
  31231. "Q": "output",
  31232. "R": "input"
  31233. },
  31234. "connections": {
  31235. "C": [ 42 ],
  31236. "D": [ 1134 ],
  31237. "Q": [ 1133 ],
  31238. "R": [ 127 ]
  31239. }
  31240. },
  31241. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O_SB_DFFR_D_Q_SB_LUT4_O": {
  31242. "hide_name": 0,
  31243. "type": "SB_LUT4",
  31244. "parameters": {
  31245. "LUT_INIT": "0001001101011111"
  31246. },
  31247. "attributes": {
  31248. "module_not_derived": "00000000000000000000000000000001",
  31249. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  31250. },
  31251. "port_directions": {
  31252. "I0": "input",
  31253. "I1": "input",
  31254. "I2": "input",
  31255. "I3": "input",
  31256. "O": "output"
  31257. },
  31258. "connections": {
  31259. "I0": [ 1149 ],
  31260. "I1": [ 1042 ],
  31261. "I2": [ 1034 ],
  31262. "I3": [ 1049 ],
  31263. "O": [ 1150 ]
  31264. }
  31265. },
  31266. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O_SB_DFFR_D_Q_SB_LUT4_O_1": {
  31267. "hide_name": 0,
  31268. "type": "SB_LUT4",
  31269. "parameters": {
  31270. "LUT_INIT": "0001001101011111"
  31271. },
  31272. "attributes": {
  31273. "module_not_derived": "00000000000000000000000000000001",
  31274. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  31275. },
  31276. "port_directions": {
  31277. "I0": "input",
  31278. "I1": "input",
  31279. "I2": "input",
  31280. "I3": "input",
  31281. "O": "output"
  31282. },
  31283. "connections": {
  31284. "I0": [ 1098 ],
  31285. "I1": [ 1037 ],
  31286. "I2": [ 1043 ],
  31287. "I3": [ 1151 ],
  31288. "O": [ 1152 ]
  31289. }
  31290. },
  31291. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O_SB_DFFR_D_Q_SB_LUT4_O_1_I3_SB_DFFER_Q": {
  31292. "hide_name": 0,
  31293. "type": "SB_DFFER",
  31294. "parameters": {
  31295. },
  31296. "attributes": {
  31297. "module_not_derived": "00000000000000000000000000000001",
  31298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  31299. },
  31300. "port_directions": {
  31301. "C": "input",
  31302. "D": "input",
  31303. "E": "input",
  31304. "Q": "output",
  31305. "R": "input"
  31306. },
  31307. "connections": {
  31308. "C": [ 42 ],
  31309. "D": [ 1054 ],
  31310. "E": [ 1040 ],
  31311. "Q": [ 1151 ],
  31312. "R": [ 127 ]
  31313. }
  31314. },
  31315. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_O": {
  31316. "hide_name": 0,
  31317. "type": "SB_LUT4",
  31318. "parameters": {
  31319. "LUT_INIT": "1111000000000000"
  31320. },
  31321. "attributes": {
  31322. "module_not_derived": "00000000000000000000000000000001",
  31323. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  31324. },
  31325. "port_directions": {
  31326. "I0": "input",
  31327. "I1": "input",
  31328. "I2": "input",
  31329. "I3": "input",
  31330. "O": "output"
  31331. },
  31332. "connections": {
  31333. "I0": [ "0" ],
  31334. "I1": [ "0" ],
  31335. "I2": [ 1035 ],
  31336. "I3": [ 1153 ],
  31337. "O": [ 1132 ]
  31338. }
  31339. },
  31340. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_O_SB_DFFR_D": {
  31341. "hide_name": 0,
  31342. "type": "SB_DFFR",
  31343. "parameters": {
  31344. },
  31345. "attributes": {
  31346. "module_not_derived": "00000000000000000000000000000001",
  31347. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  31348. },
  31349. "port_directions": {
  31350. "C": "input",
  31351. "D": "input",
  31352. "Q": "output",
  31353. "R": "input"
  31354. },
  31355. "connections": {
  31356. "C": [ 42 ],
  31357. "D": [ 1130 ],
  31358. "Q": [ 1154 ],
  31359. "R": [ 127 ]
  31360. }
  31361. },
  31362. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q": {
  31363. "hide_name": 0,
  31364. "type": "SB_DFFE",
  31365. "parameters": {
  31366. },
  31367. "attributes": {
  31368. "module_not_derived": "00000000000000000000000000000001",
  31369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31370. },
  31371. "port_directions": {
  31372. "C": "input",
  31373. "D": "input",
  31374. "E": "input",
  31375. "Q": "output"
  31376. },
  31377. "connections": {
  31378. "C": [ 42 ],
  31379. "D": [ 945 ],
  31380. "E": [ 1009 ],
  31381. "Q": [ 1061 ]
  31382. }
  31383. },
  31384. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_1": {
  31385. "hide_name": 0,
  31386. "type": "SB_DFFE",
  31387. "parameters": {
  31388. },
  31389. "attributes": {
  31390. "module_not_derived": "00000000000000000000000000000001",
  31391. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31392. },
  31393. "port_directions": {
  31394. "C": "input",
  31395. "D": "input",
  31396. "E": "input",
  31397. "Q": "output"
  31398. },
  31399. "connections": {
  31400. "C": [ 42 ],
  31401. "D": [ 947 ],
  31402. "E": [ 1009 ],
  31403. "Q": [ 1155 ]
  31404. }
  31405. },
  31406. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_10": {
  31407. "hide_name": 0,
  31408. "type": "SB_DFFE",
  31409. "parameters": {
  31410. },
  31411. "attributes": {
  31412. "module_not_derived": "00000000000000000000000000000001",
  31413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31414. },
  31415. "port_directions": {
  31416. "C": "input",
  31417. "D": "input",
  31418. "E": "input",
  31419. "Q": "output"
  31420. },
  31421. "connections": {
  31422. "C": [ 42 ],
  31423. "D": [ 949 ],
  31424. "E": [ 1009 ],
  31425. "Q": [ 1156 ]
  31426. }
  31427. },
  31428. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_11": {
  31429. "hide_name": 0,
  31430. "type": "SB_DFFE",
  31431. "parameters": {
  31432. },
  31433. "attributes": {
  31434. "module_not_derived": "00000000000000000000000000000001",
  31435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31436. },
  31437. "port_directions": {
  31438. "C": "input",
  31439. "D": "input",
  31440. "E": "input",
  31441. "Q": "output"
  31442. },
  31443. "connections": {
  31444. "C": [ 42 ],
  31445. "D": [ 951 ],
  31446. "E": [ 1009 ],
  31447. "Q": [ 1157 ]
  31448. }
  31449. },
  31450. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_12": {
  31451. "hide_name": 0,
  31452. "type": "SB_DFFE",
  31453. "parameters": {
  31454. },
  31455. "attributes": {
  31456. "module_not_derived": "00000000000000000000000000000001",
  31457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31458. },
  31459. "port_directions": {
  31460. "C": "input",
  31461. "D": "input",
  31462. "E": "input",
  31463. "Q": "output"
  31464. },
  31465. "connections": {
  31466. "C": [ 42 ],
  31467. "D": [ 953 ],
  31468. "E": [ 1009 ],
  31469. "Q": [ 1158 ]
  31470. }
  31471. },
  31472. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_13": {
  31473. "hide_name": 0,
  31474. "type": "SB_DFFE",
  31475. "parameters": {
  31476. },
  31477. "attributes": {
  31478. "module_not_derived": "00000000000000000000000000000001",
  31479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31480. },
  31481. "port_directions": {
  31482. "C": "input",
  31483. "D": "input",
  31484. "E": "input",
  31485. "Q": "output"
  31486. },
  31487. "connections": {
  31488. "C": [ 42 ],
  31489. "D": [ 955 ],
  31490. "E": [ 1009 ],
  31491. "Q": [ 1159 ]
  31492. }
  31493. },
  31494. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_14": {
  31495. "hide_name": 0,
  31496. "type": "SB_DFFE",
  31497. "parameters": {
  31498. },
  31499. "attributes": {
  31500. "module_not_derived": "00000000000000000000000000000001",
  31501. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31502. },
  31503. "port_directions": {
  31504. "C": "input",
  31505. "D": "input",
  31506. "E": "input",
  31507. "Q": "output"
  31508. },
  31509. "connections": {
  31510. "C": [ 42 ],
  31511. "D": [ 957 ],
  31512. "E": [ 1009 ],
  31513. "Q": [ 1160 ]
  31514. }
  31515. },
  31516. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_15": {
  31517. "hide_name": 0,
  31518. "type": "SB_DFFE",
  31519. "parameters": {
  31520. },
  31521. "attributes": {
  31522. "module_not_derived": "00000000000000000000000000000001",
  31523. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31524. },
  31525. "port_directions": {
  31526. "C": "input",
  31527. "D": "input",
  31528. "E": "input",
  31529. "Q": "output"
  31530. },
  31531. "connections": {
  31532. "C": [ 42 ],
  31533. "D": [ 959 ],
  31534. "E": [ 1009 ],
  31535. "Q": [ 1161 ]
  31536. }
  31537. },
  31538. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_16": {
  31539. "hide_name": 0,
  31540. "type": "SB_DFFE",
  31541. "parameters": {
  31542. },
  31543. "attributes": {
  31544. "module_not_derived": "00000000000000000000000000000001",
  31545. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31546. },
  31547. "port_directions": {
  31548. "C": "input",
  31549. "D": "input",
  31550. "E": "input",
  31551. "Q": "output"
  31552. },
  31553. "connections": {
  31554. "C": [ 42 ],
  31555. "D": [ 961 ],
  31556. "E": [ 1009 ],
  31557. "Q": [ 1162 ]
  31558. }
  31559. },
  31560. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_17": {
  31561. "hide_name": 0,
  31562. "type": "SB_DFFE",
  31563. "parameters": {
  31564. },
  31565. "attributes": {
  31566. "module_not_derived": "00000000000000000000000000000001",
  31567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31568. },
  31569. "port_directions": {
  31570. "C": "input",
  31571. "D": "input",
  31572. "E": "input",
  31573. "Q": "output"
  31574. },
  31575. "connections": {
  31576. "C": [ 42 ],
  31577. "D": [ 963 ],
  31578. "E": [ 1009 ],
  31579. "Q": [ 1163 ]
  31580. }
  31581. },
  31582. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_18": {
  31583. "hide_name": 0,
  31584. "type": "SB_DFFE",
  31585. "parameters": {
  31586. },
  31587. "attributes": {
  31588. "module_not_derived": "00000000000000000000000000000001",
  31589. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31590. },
  31591. "port_directions": {
  31592. "C": "input",
  31593. "D": "input",
  31594. "E": "input",
  31595. "Q": "output"
  31596. },
  31597. "connections": {
  31598. "C": [ 42 ],
  31599. "D": [ 965 ],
  31600. "E": [ 1009 ],
  31601. "Q": [ 1164 ]
  31602. }
  31603. },
  31604. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_19": {
  31605. "hide_name": 0,
  31606. "type": "SB_DFFE",
  31607. "parameters": {
  31608. },
  31609. "attributes": {
  31610. "module_not_derived": "00000000000000000000000000000001",
  31611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31612. },
  31613. "port_directions": {
  31614. "C": "input",
  31615. "D": "input",
  31616. "E": "input",
  31617. "Q": "output"
  31618. },
  31619. "connections": {
  31620. "C": [ 42 ],
  31621. "D": [ 967 ],
  31622. "E": [ 1009 ],
  31623. "Q": [ 1165 ]
  31624. }
  31625. },
  31626. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_2": {
  31627. "hide_name": 0,
  31628. "type": "SB_DFFE",
  31629. "parameters": {
  31630. },
  31631. "attributes": {
  31632. "module_not_derived": "00000000000000000000000000000001",
  31633. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31634. },
  31635. "port_directions": {
  31636. "C": "input",
  31637. "D": "input",
  31638. "E": "input",
  31639. "Q": "output"
  31640. },
  31641. "connections": {
  31642. "C": [ 42 ],
  31643. "D": [ 969 ],
  31644. "E": [ 1009 ],
  31645. "Q": [ 1166 ]
  31646. }
  31647. },
  31648. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_20": {
  31649. "hide_name": 0,
  31650. "type": "SB_DFFE",
  31651. "parameters": {
  31652. },
  31653. "attributes": {
  31654. "module_not_derived": "00000000000000000000000000000001",
  31655. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31656. },
  31657. "port_directions": {
  31658. "C": "input",
  31659. "D": "input",
  31660. "E": "input",
  31661. "Q": "output"
  31662. },
  31663. "connections": {
  31664. "C": [ 42 ],
  31665. "D": [ 971 ],
  31666. "E": [ 1009 ],
  31667. "Q": [ 1140 ]
  31668. }
  31669. },
  31670. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_21": {
  31671. "hide_name": 0,
  31672. "type": "SB_DFFE",
  31673. "parameters": {
  31674. },
  31675. "attributes": {
  31676. "module_not_derived": "00000000000000000000000000000001",
  31677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31678. },
  31679. "port_directions": {
  31680. "C": "input",
  31681. "D": "input",
  31682. "E": "input",
  31683. "Q": "output"
  31684. },
  31685. "connections": {
  31686. "C": [ 42 ],
  31687. "D": [ 973 ],
  31688. "E": [ 1009 ],
  31689. "Q": [ 1167 ]
  31690. }
  31691. },
  31692. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_22": {
  31693. "hide_name": 0,
  31694. "type": "SB_DFFE",
  31695. "parameters": {
  31696. },
  31697. "attributes": {
  31698. "module_not_derived": "00000000000000000000000000000001",
  31699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31700. },
  31701. "port_directions": {
  31702. "C": "input",
  31703. "D": "input",
  31704. "E": "input",
  31705. "Q": "output"
  31706. },
  31707. "connections": {
  31708. "C": [ 42 ],
  31709. "D": [ 975 ],
  31710. "E": [ 1009 ],
  31711. "Q": [ 1168 ]
  31712. }
  31713. },
  31714. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_23": {
  31715. "hide_name": 0,
  31716. "type": "SB_DFFE",
  31717. "parameters": {
  31718. },
  31719. "attributes": {
  31720. "module_not_derived": "00000000000000000000000000000001",
  31721. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31722. },
  31723. "port_directions": {
  31724. "C": "input",
  31725. "D": "input",
  31726. "E": "input",
  31727. "Q": "output"
  31728. },
  31729. "connections": {
  31730. "C": [ 42 ],
  31731. "D": [ 977 ],
  31732. "E": [ 1009 ],
  31733. "Q": [ 1169 ]
  31734. }
  31735. },
  31736. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_24": {
  31737. "hide_name": 0,
  31738. "type": "SB_DFFE",
  31739. "parameters": {
  31740. },
  31741. "attributes": {
  31742. "module_not_derived": "00000000000000000000000000000001",
  31743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31744. },
  31745. "port_directions": {
  31746. "C": "input",
  31747. "D": "input",
  31748. "E": "input",
  31749. "Q": "output"
  31750. },
  31751. "connections": {
  31752. "C": [ 42 ],
  31753. "D": [ 979 ],
  31754. "E": [ 1009 ],
  31755. "Q": [ 1149 ]
  31756. }
  31757. },
  31758. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_25": {
  31759. "hide_name": 0,
  31760. "type": "SB_DFFE",
  31761. "parameters": {
  31762. },
  31763. "attributes": {
  31764. "module_not_derived": "00000000000000000000000000000001",
  31765. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31766. },
  31767. "port_directions": {
  31768. "C": "input",
  31769. "D": "input",
  31770. "E": "input",
  31771. "Q": "output"
  31772. },
  31773. "connections": {
  31774. "C": [ 42 ],
  31775. "D": [ 981 ],
  31776. "E": [ 1009 ],
  31777. "Q": [ 1170 ]
  31778. }
  31779. },
  31780. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_26": {
  31781. "hide_name": 0,
  31782. "type": "SB_DFFE",
  31783. "parameters": {
  31784. },
  31785. "attributes": {
  31786. "module_not_derived": "00000000000000000000000000000001",
  31787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31788. },
  31789. "port_directions": {
  31790. "C": "input",
  31791. "D": "input",
  31792. "E": "input",
  31793. "Q": "output"
  31794. },
  31795. "connections": {
  31796. "C": [ 42 ],
  31797. "D": [ 983 ],
  31798. "E": [ 1009 ],
  31799. "Q": [ 1171 ]
  31800. }
  31801. },
  31802. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_27": {
  31803. "hide_name": 0,
  31804. "type": "SB_DFFE",
  31805. "parameters": {
  31806. },
  31807. "attributes": {
  31808. "module_not_derived": "00000000000000000000000000000001",
  31809. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31810. },
  31811. "port_directions": {
  31812. "C": "input",
  31813. "D": "input",
  31814. "E": "input",
  31815. "Q": "output"
  31816. },
  31817. "connections": {
  31818. "C": [ 42 ],
  31819. "D": [ 985 ],
  31820. "E": [ 1009 ],
  31821. "Q": [ 1172 ]
  31822. }
  31823. },
  31824. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_28": {
  31825. "hide_name": 0,
  31826. "type": "SB_DFFE",
  31827. "parameters": {
  31828. },
  31829. "attributes": {
  31830. "module_not_derived": "00000000000000000000000000000001",
  31831. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31832. },
  31833. "port_directions": {
  31834. "C": "input",
  31835. "D": "input",
  31836. "E": "input",
  31837. "Q": "output"
  31838. },
  31839. "connections": {
  31840. "C": [ 42 ],
  31841. "D": [ 987 ],
  31842. "E": [ 1009 ],
  31843. "Q": [ 1033 ]
  31844. }
  31845. },
  31846. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_29": {
  31847. "hide_name": 0,
  31848. "type": "SB_DFFE",
  31849. "parameters": {
  31850. },
  31851. "attributes": {
  31852. "module_not_derived": "00000000000000000000000000000001",
  31853. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31854. },
  31855. "port_directions": {
  31856. "C": "input",
  31857. "D": "input",
  31858. "E": "input",
  31859. "Q": "output"
  31860. },
  31861. "connections": {
  31862. "C": [ 42 ],
  31863. "D": [ 989 ],
  31864. "E": [ 1009 ],
  31865. "Q": [ 1173 ]
  31866. }
  31867. },
  31868. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_3": {
  31869. "hide_name": 0,
  31870. "type": "SB_DFFE",
  31871. "parameters": {
  31872. },
  31873. "attributes": {
  31874. "module_not_derived": "00000000000000000000000000000001",
  31875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31876. },
  31877. "port_directions": {
  31878. "C": "input",
  31879. "D": "input",
  31880. "E": "input",
  31881. "Q": "output"
  31882. },
  31883. "connections": {
  31884. "C": [ 42 ],
  31885. "D": [ 991 ],
  31886. "E": [ 1009 ],
  31887. "Q": [ 1174 ]
  31888. }
  31889. },
  31890. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_30": {
  31891. "hide_name": 0,
  31892. "type": "SB_DFFE",
  31893. "parameters": {
  31894. },
  31895. "attributes": {
  31896. "module_not_derived": "00000000000000000000000000000001",
  31897. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31898. },
  31899. "port_directions": {
  31900. "C": "input",
  31901. "D": "input",
  31902. "E": "input",
  31903. "Q": "output"
  31904. },
  31905. "connections": {
  31906. "C": [ 42 ],
  31907. "D": [ 993 ],
  31908. "E": [ 1009 ],
  31909. "Q": [ 1175 ]
  31910. }
  31911. },
  31912. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_31": {
  31913. "hide_name": 0,
  31914. "type": "SB_DFFE",
  31915. "parameters": {
  31916. },
  31917. "attributes": {
  31918. "module_not_derived": "00000000000000000000000000000001",
  31919. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31920. },
  31921. "port_directions": {
  31922. "C": "input",
  31923. "D": "input",
  31924. "E": "input",
  31925. "Q": "output"
  31926. },
  31927. "connections": {
  31928. "C": [ 42 ],
  31929. "D": [ 995 ],
  31930. "E": [ 1009 ],
  31931. "Q": [ 1176 ]
  31932. }
  31933. },
  31934. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_4": {
  31935. "hide_name": 0,
  31936. "type": "SB_DFFE",
  31937. "parameters": {
  31938. },
  31939. "attributes": {
  31940. "module_not_derived": "00000000000000000000000000000001",
  31941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31942. },
  31943. "port_directions": {
  31944. "C": "input",
  31945. "D": "input",
  31946. "E": "input",
  31947. "Q": "output"
  31948. },
  31949. "connections": {
  31950. "C": [ 42 ],
  31951. "D": [ 997 ],
  31952. "E": [ 1009 ],
  31953. "Q": [ 1177 ]
  31954. }
  31955. },
  31956. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_5": {
  31957. "hide_name": 0,
  31958. "type": "SB_DFFE",
  31959. "parameters": {
  31960. },
  31961. "attributes": {
  31962. "module_not_derived": "00000000000000000000000000000001",
  31963. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31964. },
  31965. "port_directions": {
  31966. "C": "input",
  31967. "D": "input",
  31968. "E": "input",
  31969. "Q": "output"
  31970. },
  31971. "connections": {
  31972. "C": [ 42 ],
  31973. "D": [ 999 ],
  31974. "E": [ 1009 ],
  31975. "Q": [ 1178 ]
  31976. }
  31977. },
  31978. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_6": {
  31979. "hide_name": 0,
  31980. "type": "SB_DFFE",
  31981. "parameters": {
  31982. },
  31983. "attributes": {
  31984. "module_not_derived": "00000000000000000000000000000001",
  31985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  31986. },
  31987. "port_directions": {
  31988. "C": "input",
  31989. "D": "input",
  31990. "E": "input",
  31991. "Q": "output"
  31992. },
  31993. "connections": {
  31994. "C": [ 42 ],
  31995. "D": [ 1001 ],
  31996. "E": [ 1009 ],
  31997. "Q": [ 1179 ]
  31998. }
  31999. },
  32000. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_7": {
  32001. "hide_name": 0,
  32002. "type": "SB_DFFE",
  32003. "parameters": {
  32004. },
  32005. "attributes": {
  32006. "module_not_derived": "00000000000000000000000000000001",
  32007. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32008. },
  32009. "port_directions": {
  32010. "C": "input",
  32011. "D": "input",
  32012. "E": "input",
  32013. "Q": "output"
  32014. },
  32015. "connections": {
  32016. "C": [ 42 ],
  32017. "D": [ 1003 ],
  32018. "E": [ 1009 ],
  32019. "Q": [ 1180 ]
  32020. }
  32021. },
  32022. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_8": {
  32023. "hide_name": 0,
  32024. "type": "SB_DFFE",
  32025. "parameters": {
  32026. },
  32027. "attributes": {
  32028. "module_not_derived": "00000000000000000000000000000001",
  32029. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32030. },
  32031. "port_directions": {
  32032. "C": "input",
  32033. "D": "input",
  32034. "E": "input",
  32035. "Q": "output"
  32036. },
  32037. "connections": {
  32038. "C": [ 42 ],
  32039. "D": [ 1005 ],
  32040. "E": [ 1009 ],
  32041. "Q": [ 1181 ]
  32042. }
  32043. },
  32044. "cpu_I.CsrPlugin_mtval_SB_DFFE_Q_9": {
  32045. "hide_name": 0,
  32046. "type": "SB_DFFE",
  32047. "parameters": {
  32048. },
  32049. "attributes": {
  32050. "module_not_derived": "00000000000000000000000000000001",
  32051. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32052. },
  32053. "port_directions": {
  32054. "C": "input",
  32055. "D": "input",
  32056. "E": "input",
  32057. "Q": "output"
  32058. },
  32059. "connections": {
  32060. "C": [ 42 ],
  32061. "D": [ 1007 ],
  32062. "E": [ 1009 ],
  32063. "Q": [ 1182 ]
  32064. }
  32065. },
  32066. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q": {
  32067. "hide_name": 0,
  32068. "type": "SB_DFFE",
  32069. "parameters": {
  32070. },
  32071. "attributes": {
  32072. "module_not_derived": "00000000000000000000000000000001",
  32073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32074. },
  32075. "port_directions": {
  32076. "C": "input",
  32077. "D": "input",
  32078. "E": "input",
  32079. "Q": "output"
  32080. },
  32081. "connections": {
  32082. "C": [ 42 ],
  32083. "D": [ 1059 ],
  32084. "E": [ 1183 ],
  32085. "Q": [ 1184 ]
  32086. }
  32087. },
  32088. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_1": {
  32089. "hide_name": 0,
  32090. "type": "SB_DFFE",
  32091. "parameters": {
  32092. },
  32093. "attributes": {
  32094. "module_not_derived": "00000000000000000000000000000001",
  32095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32096. },
  32097. "port_directions": {
  32098. "C": "input",
  32099. "D": "input",
  32100. "E": "input",
  32101. "Q": "output"
  32102. },
  32103. "connections": {
  32104. "C": [ 42 ],
  32105. "D": [ 1185 ],
  32106. "E": [ 1183 ],
  32107. "Q": [ 1186 ]
  32108. }
  32109. },
  32110. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_10": {
  32111. "hide_name": 0,
  32112. "type": "SB_DFFE",
  32113. "parameters": {
  32114. },
  32115. "attributes": {
  32116. "module_not_derived": "00000000000000000000000000000001",
  32117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32118. },
  32119. "port_directions": {
  32120. "C": "input",
  32121. "D": "input",
  32122. "E": "input",
  32123. "Q": "output"
  32124. },
  32125. "connections": {
  32126. "C": [ 42 ],
  32127. "D": [ 1187 ],
  32128. "E": [ 1183 ],
  32129. "Q": [ 1188 ]
  32130. }
  32131. },
  32132. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_11": {
  32133. "hide_name": 0,
  32134. "type": "SB_DFFE",
  32135. "parameters": {
  32136. },
  32137. "attributes": {
  32138. "module_not_derived": "00000000000000000000000000000001",
  32139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32140. },
  32141. "port_directions": {
  32142. "C": "input",
  32143. "D": "input",
  32144. "E": "input",
  32145. "Q": "output"
  32146. },
  32147. "connections": {
  32148. "C": [ 42 ],
  32149. "D": [ 1189 ],
  32150. "E": [ 1183 ],
  32151. "Q": [ 1190 ]
  32152. }
  32153. },
  32154. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_12": {
  32155. "hide_name": 0,
  32156. "type": "SB_DFFE",
  32157. "parameters": {
  32158. },
  32159. "attributes": {
  32160. "module_not_derived": "00000000000000000000000000000001",
  32161. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32162. },
  32163. "port_directions": {
  32164. "C": "input",
  32165. "D": "input",
  32166. "E": "input",
  32167. "Q": "output"
  32168. },
  32169. "connections": {
  32170. "C": [ 42 ],
  32171. "D": [ 1191 ],
  32172. "E": [ 1183 ],
  32173. "Q": [ 1192 ]
  32174. }
  32175. },
  32176. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_13": {
  32177. "hide_name": 0,
  32178. "type": "SB_DFFE",
  32179. "parameters": {
  32180. },
  32181. "attributes": {
  32182. "module_not_derived": "00000000000000000000000000000001",
  32183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32184. },
  32185. "port_directions": {
  32186. "C": "input",
  32187. "D": "input",
  32188. "E": "input",
  32189. "Q": "output"
  32190. },
  32191. "connections": {
  32192. "C": [ 42 ],
  32193. "D": [ 1193 ],
  32194. "E": [ 1183 ],
  32195. "Q": [ 1194 ]
  32196. }
  32197. },
  32198. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_14": {
  32199. "hide_name": 0,
  32200. "type": "SB_DFFE",
  32201. "parameters": {
  32202. },
  32203. "attributes": {
  32204. "module_not_derived": "00000000000000000000000000000001",
  32205. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32206. },
  32207. "port_directions": {
  32208. "C": "input",
  32209. "D": "input",
  32210. "E": "input",
  32211. "Q": "output"
  32212. },
  32213. "connections": {
  32214. "C": [ 42 ],
  32215. "D": [ 1195 ],
  32216. "E": [ 1183 ],
  32217. "Q": [ 1196 ]
  32218. }
  32219. },
  32220. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_15": {
  32221. "hide_name": 0,
  32222. "type": "SB_DFFE",
  32223. "parameters": {
  32224. },
  32225. "attributes": {
  32226. "module_not_derived": "00000000000000000000000000000001",
  32227. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32228. },
  32229. "port_directions": {
  32230. "C": "input",
  32231. "D": "input",
  32232. "E": "input",
  32233. "Q": "output"
  32234. },
  32235. "connections": {
  32236. "C": [ 42 ],
  32237. "D": [ 1197 ],
  32238. "E": [ 1183 ],
  32239. "Q": [ 1198 ]
  32240. }
  32241. },
  32242. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_16": {
  32243. "hide_name": 0,
  32244. "type": "SB_DFFE",
  32245. "parameters": {
  32246. },
  32247. "attributes": {
  32248. "module_not_derived": "00000000000000000000000000000001",
  32249. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32250. },
  32251. "port_directions": {
  32252. "C": "input",
  32253. "D": "input",
  32254. "E": "input",
  32255. "Q": "output"
  32256. },
  32257. "connections": {
  32258. "C": [ 42 ],
  32259. "D": [ 1199 ],
  32260. "E": [ 1183 ],
  32261. "Q": [ 1200 ]
  32262. }
  32263. },
  32264. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_17": {
  32265. "hide_name": 0,
  32266. "type": "SB_DFFE",
  32267. "parameters": {
  32268. },
  32269. "attributes": {
  32270. "module_not_derived": "00000000000000000000000000000001",
  32271. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32272. },
  32273. "port_directions": {
  32274. "C": "input",
  32275. "D": "input",
  32276. "E": "input",
  32277. "Q": "output"
  32278. },
  32279. "connections": {
  32280. "C": [ 42 ],
  32281. "D": [ 1201 ],
  32282. "E": [ 1183 ],
  32283. "Q": [ 1202 ]
  32284. }
  32285. },
  32286. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_18": {
  32287. "hide_name": 0,
  32288. "type": "SB_DFFE",
  32289. "parameters": {
  32290. },
  32291. "attributes": {
  32292. "module_not_derived": "00000000000000000000000000000001",
  32293. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32294. },
  32295. "port_directions": {
  32296. "C": "input",
  32297. "D": "input",
  32298. "E": "input",
  32299. "Q": "output"
  32300. },
  32301. "connections": {
  32302. "C": [ 42 ],
  32303. "D": [ 1203 ],
  32304. "E": [ 1183 ],
  32305. "Q": [ 1204 ]
  32306. }
  32307. },
  32308. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_19": {
  32309. "hide_name": 0,
  32310. "type": "SB_DFFE",
  32311. "parameters": {
  32312. },
  32313. "attributes": {
  32314. "module_not_derived": "00000000000000000000000000000001",
  32315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32316. },
  32317. "port_directions": {
  32318. "C": "input",
  32319. "D": "input",
  32320. "E": "input",
  32321. "Q": "output"
  32322. },
  32323. "connections": {
  32324. "C": [ 42 ],
  32325. "D": [ 1146 ],
  32326. "E": [ 1183 ],
  32327. "Q": [ 1205 ]
  32328. }
  32329. },
  32330. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_2": {
  32331. "hide_name": 0,
  32332. "type": "SB_DFFE",
  32333. "parameters": {
  32334. },
  32335. "attributes": {
  32336. "module_not_derived": "00000000000000000000000000000001",
  32337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32338. },
  32339. "port_directions": {
  32340. "C": "input",
  32341. "D": "input",
  32342. "E": "input",
  32343. "Q": "output"
  32344. },
  32345. "connections": {
  32346. "C": [ 42 ],
  32347. "D": [ 1206 ],
  32348. "E": [ 1183 ],
  32349. "Q": [ 1207 ]
  32350. }
  32351. },
  32352. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_20": {
  32353. "hide_name": 0,
  32354. "type": "SB_DFFE",
  32355. "parameters": {
  32356. },
  32357. "attributes": {
  32358. "module_not_derived": "00000000000000000000000000000001",
  32359. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32360. },
  32361. "port_directions": {
  32362. "C": "input",
  32363. "D": "input",
  32364. "E": "input",
  32365. "Q": "output"
  32366. },
  32367. "connections": {
  32368. "C": [ 42 ],
  32369. "D": [ 1136 ],
  32370. "E": [ 1183 ],
  32371. "Q": [ 1208 ]
  32372. }
  32373. },
  32374. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_21": {
  32375. "hide_name": 0,
  32376. "type": "SB_DFFE",
  32377. "parameters": {
  32378. },
  32379. "attributes": {
  32380. "module_not_derived": "00000000000000000000000000000001",
  32381. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32382. },
  32383. "port_directions": {
  32384. "C": "input",
  32385. "D": "input",
  32386. "E": "input",
  32387. "Q": "output"
  32388. },
  32389. "connections": {
  32390. "C": [ 42 ],
  32391. "D": [ 1209 ],
  32392. "E": [ 1183 ],
  32393. "Q": [ 1210 ]
  32394. }
  32395. },
  32396. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_22": {
  32397. "hide_name": 0,
  32398. "type": "SB_DFFE",
  32399. "parameters": {
  32400. },
  32401. "attributes": {
  32402. "module_not_derived": "00000000000000000000000000000001",
  32403. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32404. },
  32405. "port_directions": {
  32406. "C": "input",
  32407. "D": "input",
  32408. "E": "input",
  32409. "Q": "output"
  32410. },
  32411. "connections": {
  32412. "C": [ 42 ],
  32413. "D": [ 1211 ],
  32414. "E": [ 1183 ],
  32415. "Q": [ 1212 ]
  32416. }
  32417. },
  32418. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_23": {
  32419. "hide_name": 0,
  32420. "type": "SB_DFFE",
  32421. "parameters": {
  32422. },
  32423. "attributes": {
  32424. "module_not_derived": "00000000000000000000000000000001",
  32425. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32426. },
  32427. "port_directions": {
  32428. "C": "input",
  32429. "D": "input",
  32430. "E": "input",
  32431. "Q": "output"
  32432. },
  32433. "connections": {
  32434. "C": [ 42 ],
  32435. "D": [ 1213 ],
  32436. "E": [ 1183 ],
  32437. "Q": [ 1214 ]
  32438. }
  32439. },
  32440. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_24": {
  32441. "hide_name": 0,
  32442. "type": "SB_DFFE",
  32443. "parameters": {
  32444. },
  32445. "attributes": {
  32446. "module_not_derived": "00000000000000000000000000000001",
  32447. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32448. },
  32449. "port_directions": {
  32450. "C": "input",
  32451. "D": "input",
  32452. "E": "input",
  32453. "Q": "output"
  32454. },
  32455. "connections": {
  32456. "C": [ 42 ],
  32457. "D": [ 1054 ],
  32458. "E": [ 1183 ],
  32459. "Q": [ 1215 ]
  32460. }
  32461. },
  32462. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_25": {
  32463. "hide_name": 0,
  32464. "type": "SB_DFFE",
  32465. "parameters": {
  32466. },
  32467. "attributes": {
  32468. "module_not_derived": "00000000000000000000000000000001",
  32469. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32470. },
  32471. "port_directions": {
  32472. "C": "input",
  32473. "D": "input",
  32474. "E": "input",
  32475. "Q": "output"
  32476. },
  32477. "connections": {
  32478. "C": [ 42 ],
  32479. "D": [ 1216 ],
  32480. "E": [ 1183 ],
  32481. "Q": [ 1217 ]
  32482. }
  32483. },
  32484. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_26": {
  32485. "hide_name": 0,
  32486. "type": "SB_DFFE",
  32487. "parameters": {
  32488. },
  32489. "attributes": {
  32490. "module_not_derived": "00000000000000000000000000000001",
  32491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32492. },
  32493. "port_directions": {
  32494. "C": "input",
  32495. "D": "input",
  32496. "E": "input",
  32497. "Q": "output"
  32498. },
  32499. "connections": {
  32500. "C": [ 42 ],
  32501. "D": [ 1218 ],
  32502. "E": [ 1183 ],
  32503. "Q": [ 1219 ]
  32504. }
  32505. },
  32506. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_27": {
  32507. "hide_name": 0,
  32508. "type": "SB_DFFE",
  32509. "parameters": {
  32510. },
  32511. "attributes": {
  32512. "module_not_derived": "00000000000000000000000000000001",
  32513. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32514. },
  32515. "port_directions": {
  32516. "C": "input",
  32517. "D": "input",
  32518. "E": "input",
  32519. "Q": "output"
  32520. },
  32521. "connections": {
  32522. "C": [ 42 ],
  32523. "D": [ 1220 ],
  32524. "E": [ 1183 ],
  32525. "Q": [ 1221 ]
  32526. }
  32527. },
  32528. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_28": {
  32529. "hide_name": 0,
  32530. "type": "SB_DFFE",
  32531. "parameters": {
  32532. },
  32533. "attributes": {
  32534. "module_not_derived": "00000000000000000000000000000001",
  32535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32536. },
  32537. "port_directions": {
  32538. "C": "input",
  32539. "D": "input",
  32540. "E": "input",
  32541. "Q": "output"
  32542. },
  32543. "connections": {
  32544. "C": [ 42 ],
  32545. "D": [ 1039 ],
  32546. "E": [ 1183 ],
  32547. "Q": [ 1222 ]
  32548. }
  32549. },
  32550. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_29": {
  32551. "hide_name": 0,
  32552. "type": "SB_DFFE",
  32553. "parameters": {
  32554. },
  32555. "attributes": {
  32556. "module_not_derived": "00000000000000000000000000000001",
  32557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32558. },
  32559. "port_directions": {
  32560. "C": "input",
  32561. "D": "input",
  32562. "E": "input",
  32563. "Q": "output"
  32564. },
  32565. "connections": {
  32566. "C": [ 42 ],
  32567. "D": [ 1223 ],
  32568. "E": [ 1183 ],
  32569. "Q": [ 1224 ]
  32570. }
  32571. },
  32572. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_3": {
  32573. "hide_name": 0,
  32574. "type": "SB_DFFE",
  32575. "parameters": {
  32576. },
  32577. "attributes": {
  32578. "module_not_derived": "00000000000000000000000000000001",
  32579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32580. },
  32581. "port_directions": {
  32582. "C": "input",
  32583. "D": "input",
  32584. "E": "input",
  32585. "Q": "output"
  32586. },
  32587. "connections": {
  32588. "C": [ 42 ],
  32589. "D": [ 1225 ],
  32590. "E": [ 1183 ],
  32591. "Q": [ 1226 ]
  32592. }
  32593. },
  32594. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_4": {
  32595. "hide_name": 0,
  32596. "type": "SB_DFFE",
  32597. "parameters": {
  32598. },
  32599. "attributes": {
  32600. "module_not_derived": "00000000000000000000000000000001",
  32601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32602. },
  32603. "port_directions": {
  32604. "C": "input",
  32605. "D": "input",
  32606. "E": "input",
  32607. "Q": "output"
  32608. },
  32609. "connections": {
  32610. "C": [ 42 ],
  32611. "D": [ 1227 ],
  32612. "E": [ 1183 ],
  32613. "Q": [ 1228 ]
  32614. }
  32615. },
  32616. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_5": {
  32617. "hide_name": 0,
  32618. "type": "SB_DFFE",
  32619. "parameters": {
  32620. },
  32621. "attributes": {
  32622. "module_not_derived": "00000000000000000000000000000001",
  32623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32624. },
  32625. "port_directions": {
  32626. "C": "input",
  32627. "D": "input",
  32628. "E": "input",
  32629. "Q": "output"
  32630. },
  32631. "connections": {
  32632. "C": [ 42 ],
  32633. "D": [ 1229 ],
  32634. "E": [ 1183 ],
  32635. "Q": [ 1230 ]
  32636. }
  32637. },
  32638. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_6": {
  32639. "hide_name": 0,
  32640. "type": "SB_DFFE",
  32641. "parameters": {
  32642. },
  32643. "attributes": {
  32644. "module_not_derived": "00000000000000000000000000000001",
  32645. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32646. },
  32647. "port_directions": {
  32648. "C": "input",
  32649. "D": "input",
  32650. "E": "input",
  32651. "Q": "output"
  32652. },
  32653. "connections": {
  32654. "C": [ 42 ],
  32655. "D": [ 1231 ],
  32656. "E": [ 1183 ],
  32657. "Q": [ 1232 ]
  32658. }
  32659. },
  32660. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_7": {
  32661. "hide_name": 0,
  32662. "type": "SB_DFFE",
  32663. "parameters": {
  32664. },
  32665. "attributes": {
  32666. "module_not_derived": "00000000000000000000000000000001",
  32667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32668. },
  32669. "port_directions": {
  32670. "C": "input",
  32671. "D": "input",
  32672. "E": "input",
  32673. "Q": "output"
  32674. },
  32675. "connections": {
  32676. "C": [ 42 ],
  32677. "D": [ 1233 ],
  32678. "E": [ 1183 ],
  32679. "Q": [ 1234 ]
  32680. }
  32681. },
  32682. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_8": {
  32683. "hide_name": 0,
  32684. "type": "SB_DFFE",
  32685. "parameters": {
  32686. },
  32687. "attributes": {
  32688. "module_not_derived": "00000000000000000000000000000001",
  32689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32690. },
  32691. "port_directions": {
  32692. "C": "input",
  32693. "D": "input",
  32694. "E": "input",
  32695. "Q": "output"
  32696. },
  32697. "connections": {
  32698. "C": [ 42 ],
  32699. "D": [ 1235 ],
  32700. "E": [ 1183 ],
  32701. "Q": [ 1236 ]
  32702. }
  32703. },
  32704. "cpu_I.CsrPlugin_mtvec_base_SB_DFFE_Q_9": {
  32705. "hide_name": 0,
  32706. "type": "SB_DFFE",
  32707. "parameters": {
  32708. },
  32709. "attributes": {
  32710. "module_not_derived": "00000000000000000000000000000001",
  32711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  32712. },
  32713. "port_directions": {
  32714. "C": "input",
  32715. "D": "input",
  32716. "E": "input",
  32717. "Q": "output"
  32718. },
  32719. "connections": {
  32720. "C": [ 42 ],
  32721. "D": [ 1237 ],
  32722. "E": [ 1183 ],
  32723. "Q": [ 1238 ]
  32724. }
  32725. },
  32726. "cpu_I.CsrPlugin_selfException_valid_SB_LUT4_O": {
  32727. "hide_name": 0,
  32728. "type": "SB_LUT4",
  32729. "parameters": {
  32730. "LUT_INIT": "0000110000000000"
  32731. },
  32732. "attributes": {
  32733. "module_not_derived": "00000000000000000000000000000001",
  32734. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32735. },
  32736. "port_directions": {
  32737. "I0": "input",
  32738. "I1": "input",
  32739. "I2": "input",
  32740. "I3": "input",
  32741. "O": "output"
  32742. },
  32743. "connections": {
  32744. "I0": [ "0" ],
  32745. "I1": [ 1239 ],
  32746. "I2": [ 1240 ],
  32747. "I3": [ 1241 ],
  32748. "O": [ 944 ]
  32749. }
  32750. },
  32751. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3": {
  32752. "hide_name": 0,
  32753. "type": "SB_LUT4",
  32754. "parameters": {
  32755. "LUT_INIT": "0000001100001111"
  32756. },
  32757. "attributes": {
  32758. "module_not_derived": "00000000000000000000000000000001",
  32759. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32760. },
  32761. "port_directions": {
  32762. "I0": "input",
  32763. "I1": "input",
  32764. "I2": "input",
  32765. "I3": "input",
  32766. "O": "output"
  32767. },
  32768. "connections": {
  32769. "I0": [ "0" ],
  32770. "I1": [ 1242 ],
  32771. "I2": [ 1243 ],
  32772. "I3": [ 1244 ],
  32773. "O": [ 1245 ]
  32774. }
  32775. },
  32776. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_I2_SB_LUT4_O": {
  32777. "hide_name": 0,
  32778. "type": "SB_LUT4",
  32779. "parameters": {
  32780. "LUT_INIT": "0000000000000010"
  32781. },
  32782. "attributes": {
  32783. "module_not_derived": "00000000000000000000000000000001",
  32784. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  32785. },
  32786. "port_directions": {
  32787. "I0": "input",
  32788. "I1": "input",
  32789. "I2": "input",
  32790. "I3": "input",
  32791. "O": "output"
  32792. },
  32793. "connections": {
  32794. "I0": [ 1246 ],
  32795. "I1": [ 1247 ],
  32796. "I2": [ 1248 ],
  32797. "I3": [ 1249 ],
  32798. "O": [ 1243 ]
  32799. }
  32800. },
  32801. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  32802. "hide_name": 0,
  32803. "type": "SB_LUT4",
  32804. "parameters": {
  32805. "LUT_INIT": "0010001000000010"
  32806. },
  32807. "attributes": {
  32808. "module_not_derived": "00000000000000000000000000000001",
  32809. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  32810. },
  32811. "port_directions": {
  32812. "I0": "input",
  32813. "I1": "input",
  32814. "I2": "input",
  32815. "I3": "input",
  32816. "O": "output"
  32817. },
  32818. "connections": {
  32819. "I0": [ 966 ],
  32820. "I1": [ 1250 ],
  32821. "I2": [ 1251 ],
  32822. "I3": [ 1252 ],
  32823. "O": [ 1248 ]
  32824. }
  32825. },
  32826. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  32827. "hide_name": 0,
  32828. "type": "SB_LUT4",
  32829. "parameters": {
  32830. "LUT_INIT": "0000110110010000"
  32831. },
  32832. "attributes": {
  32833. "module_not_derived": "00000000000000000000000000000001",
  32834. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  32835. },
  32836. "port_directions": {
  32837. "I0": "input",
  32838. "I1": "input",
  32839. "I2": "input",
  32840. "I3": "input",
  32841. "O": "output"
  32842. },
  32843. "connections": {
  32844. "I0": [ 966 ],
  32845. "I1": [ 1250 ],
  32846. "I2": [ 1251 ],
  32847. "I3": [ 1252 ],
  32848. "O": [ 1249 ]
  32849. }
  32850. },
  32851. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_O_SB_LUT4_O": {
  32852. "hide_name": 0,
  32853. "type": "SB_LUT4",
  32854. "parameters": {
  32855. "LUT_INIT": "0000011100000000"
  32856. },
  32857. "attributes": {
  32858. "module_not_derived": "00000000000000000000000000000001",
  32859. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  32860. },
  32861. "port_directions": {
  32862. "I0": "input",
  32863. "I1": "input",
  32864. "I2": "input",
  32865. "I3": "input",
  32866. "O": "output"
  32867. },
  32868. "connections": {
  32869. "I0": [ 1037 ],
  32870. "I1": [ 1060 ],
  32871. "I2": [ 1058 ],
  32872. "I3": [ 1063 ],
  32873. "O": [ 1253 ]
  32874. }
  32875. },
  32876. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_O": {
  32877. "hide_name": 0,
  32878. "type": "SB_LUT4",
  32879. "parameters": {
  32880. "LUT_INIT": "1111001111000000"
  32881. },
  32882. "attributes": {
  32883. "module_not_derived": "00000000000000000000000000000001",
  32884. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32885. },
  32886. "port_directions": {
  32887. "I0": "input",
  32888. "I1": "input",
  32889. "I2": "input",
  32890. "I3": "input",
  32891. "O": "output"
  32892. },
  32893. "connections": {
  32894. "I0": [ "0" ],
  32895. "I1": [ 1254 ],
  32896. "I2": [ 1251 ],
  32897. "I3": [ 1255 ],
  32898. "O": [ 1244 ]
  32899. }
  32900. },
  32901. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O": {
  32902. "hide_name": 0,
  32903. "type": "SB_LUT4",
  32904. "parameters": {
  32905. "LUT_INIT": "1111000011001100"
  32906. },
  32907. "attributes": {
  32908. "module_not_derived": "00000000000000000000000000000001",
  32909. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32910. },
  32911. "port_directions": {
  32912. "I0": "input",
  32913. "I1": "input",
  32914. "I2": "input",
  32915. "I3": "input",
  32916. "O": "output"
  32917. },
  32918. "connections": {
  32919. "I0": [ "0" ],
  32920. "I1": [ 1256 ],
  32921. "I2": [ 1257 ],
  32922. "I3": [ 1258 ],
  32923. "O": [ 1259 ]
  32924. }
  32925. },
  32926. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_1": {
  32927. "hide_name": 0,
  32928. "type": "SB_LUT4",
  32929. "parameters": {
  32930. "LUT_INIT": "1111000011001100"
  32931. },
  32932. "attributes": {
  32933. "module_not_derived": "00000000000000000000000000000001",
  32934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32935. },
  32936. "port_directions": {
  32937. "I0": "input",
  32938. "I1": "input",
  32939. "I2": "input",
  32940. "I3": "input",
  32941. "O": "output"
  32942. },
  32943. "connections": {
  32944. "I0": [ "0" ],
  32945. "I1": [ 1260 ],
  32946. "I2": [ 1261 ],
  32947. "I3": [ 1258 ],
  32948. "O": [ 1262 ]
  32949. }
  32950. },
  32951. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_10": {
  32952. "hide_name": 0,
  32953. "type": "SB_LUT4",
  32954. "parameters": {
  32955. "LUT_INIT": "1111000011001100"
  32956. },
  32957. "attributes": {
  32958. "module_not_derived": "00000000000000000000000000000001",
  32959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32960. },
  32961. "port_directions": {
  32962. "I0": "input",
  32963. "I1": "input",
  32964. "I2": "input",
  32965. "I3": "input",
  32966. "O": "output"
  32967. },
  32968. "connections": {
  32969. "I0": [ "0" ],
  32970. "I1": [ 1263 ],
  32971. "I2": [ 1264 ],
  32972. "I3": [ 1258 ],
  32973. "O": [ 1265 ]
  32974. }
  32975. },
  32976. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_11": {
  32977. "hide_name": 0,
  32978. "type": "SB_LUT4",
  32979. "parameters": {
  32980. "LUT_INIT": "1111000011001100"
  32981. },
  32982. "attributes": {
  32983. "module_not_derived": "00000000000000000000000000000001",
  32984. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  32985. },
  32986. "port_directions": {
  32987. "I0": "input",
  32988. "I1": "input",
  32989. "I2": "input",
  32990. "I3": "input",
  32991. "O": "output"
  32992. },
  32993. "connections": {
  32994. "I0": [ "0" ],
  32995. "I1": [ 1266 ],
  32996. "I2": [ 1267 ],
  32997. "I3": [ 1258 ],
  32998. "O": [ 1268 ]
  32999. }
  33000. },
  33001. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_12": {
  33002. "hide_name": 0,
  33003. "type": "SB_LUT4",
  33004. "parameters": {
  33005. "LUT_INIT": "1111000011001100"
  33006. },
  33007. "attributes": {
  33008. "module_not_derived": "00000000000000000000000000000001",
  33009. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33010. },
  33011. "port_directions": {
  33012. "I0": "input",
  33013. "I1": "input",
  33014. "I2": "input",
  33015. "I3": "input",
  33016. "O": "output"
  33017. },
  33018. "connections": {
  33019. "I0": [ "0" ],
  33020. "I1": [ 1269 ],
  33021. "I2": [ 1270 ],
  33022. "I3": [ 1258 ],
  33023. "O": [ 1271 ]
  33024. }
  33025. },
  33026. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_13": {
  33027. "hide_name": 0,
  33028. "type": "SB_LUT4",
  33029. "parameters": {
  33030. "LUT_INIT": "1111000011001100"
  33031. },
  33032. "attributes": {
  33033. "module_not_derived": "00000000000000000000000000000001",
  33034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33035. },
  33036. "port_directions": {
  33037. "I0": "input",
  33038. "I1": "input",
  33039. "I2": "input",
  33040. "I3": "input",
  33041. "O": "output"
  33042. },
  33043. "connections": {
  33044. "I0": [ "0" ],
  33045. "I1": [ 1272 ],
  33046. "I2": [ 1273 ],
  33047. "I3": [ 1258 ],
  33048. "O": [ 1274 ]
  33049. }
  33050. },
  33051. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_14": {
  33052. "hide_name": 0,
  33053. "type": "SB_LUT4",
  33054. "parameters": {
  33055. "LUT_INIT": "1111000011001100"
  33056. },
  33057. "attributes": {
  33058. "module_not_derived": "00000000000000000000000000000001",
  33059. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33060. },
  33061. "port_directions": {
  33062. "I0": "input",
  33063. "I1": "input",
  33064. "I2": "input",
  33065. "I3": "input",
  33066. "O": "output"
  33067. },
  33068. "connections": {
  33069. "I0": [ "0" ],
  33070. "I1": [ 1275 ],
  33071. "I2": [ 1276 ],
  33072. "I3": [ 1258 ],
  33073. "O": [ 1277 ]
  33074. }
  33075. },
  33076. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_15": {
  33077. "hide_name": 0,
  33078. "type": "SB_LUT4",
  33079. "parameters": {
  33080. "LUT_INIT": "1111000011001100"
  33081. },
  33082. "attributes": {
  33083. "module_not_derived": "00000000000000000000000000000001",
  33084. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33085. },
  33086. "port_directions": {
  33087. "I0": "input",
  33088. "I1": "input",
  33089. "I2": "input",
  33090. "I3": "input",
  33091. "O": "output"
  33092. },
  33093. "connections": {
  33094. "I0": [ "0" ],
  33095. "I1": [ 1278 ],
  33096. "I2": [ 1279 ],
  33097. "I3": [ 1258 ],
  33098. "O": [ 1280 ]
  33099. }
  33100. },
  33101. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_16": {
  33102. "hide_name": 0,
  33103. "type": "SB_LUT4",
  33104. "parameters": {
  33105. "LUT_INIT": "1111000011001100"
  33106. },
  33107. "attributes": {
  33108. "module_not_derived": "00000000000000000000000000000001",
  33109. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33110. },
  33111. "port_directions": {
  33112. "I0": "input",
  33113. "I1": "input",
  33114. "I2": "input",
  33115. "I3": "input",
  33116. "O": "output"
  33117. },
  33118. "connections": {
  33119. "I0": [ "0" ],
  33120. "I1": [ 1281 ],
  33121. "I2": [ 1282 ],
  33122. "I3": [ 1258 ],
  33123. "O": [ 1283 ]
  33124. }
  33125. },
  33126. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_17": {
  33127. "hide_name": 0,
  33128. "type": "SB_LUT4",
  33129. "parameters": {
  33130. "LUT_INIT": "1111000011001100"
  33131. },
  33132. "attributes": {
  33133. "module_not_derived": "00000000000000000000000000000001",
  33134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33135. },
  33136. "port_directions": {
  33137. "I0": "input",
  33138. "I1": "input",
  33139. "I2": "input",
  33140. "I3": "input",
  33141. "O": "output"
  33142. },
  33143. "connections": {
  33144. "I0": [ "0" ],
  33145. "I1": [ 1284 ],
  33146. "I2": [ 1285 ],
  33147. "I3": [ 1258 ],
  33148. "O": [ 1286 ]
  33149. }
  33150. },
  33151. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_18": {
  33152. "hide_name": 0,
  33153. "type": "SB_LUT4",
  33154. "parameters": {
  33155. "LUT_INIT": "1111000011001100"
  33156. },
  33157. "attributes": {
  33158. "module_not_derived": "00000000000000000000000000000001",
  33159. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33160. },
  33161. "port_directions": {
  33162. "I0": "input",
  33163. "I1": "input",
  33164. "I2": "input",
  33165. "I3": "input",
  33166. "O": "output"
  33167. },
  33168. "connections": {
  33169. "I0": [ "0" ],
  33170. "I1": [ 1287 ],
  33171. "I2": [ 1288 ],
  33172. "I3": [ 1258 ],
  33173. "O": [ 1289 ]
  33174. }
  33175. },
  33176. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_19": {
  33177. "hide_name": 0,
  33178. "type": "SB_LUT4",
  33179. "parameters": {
  33180. "LUT_INIT": "1111000011001100"
  33181. },
  33182. "attributes": {
  33183. "module_not_derived": "00000000000000000000000000000001",
  33184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33185. },
  33186. "port_directions": {
  33187. "I0": "input",
  33188. "I1": "input",
  33189. "I2": "input",
  33190. "I3": "input",
  33191. "O": "output"
  33192. },
  33193. "connections": {
  33194. "I0": [ "0" ],
  33195. "I1": [ 1290 ],
  33196. "I2": [ 1291 ],
  33197. "I3": [ 1258 ],
  33198. "O": [ 1292 ]
  33199. }
  33200. },
  33201. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_2": {
  33202. "hide_name": 0,
  33203. "type": "SB_LUT4",
  33204. "parameters": {
  33205. "LUT_INIT": "1111000011001100"
  33206. },
  33207. "attributes": {
  33208. "module_not_derived": "00000000000000000000000000000001",
  33209. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33210. },
  33211. "port_directions": {
  33212. "I0": "input",
  33213. "I1": "input",
  33214. "I2": "input",
  33215. "I3": "input",
  33216. "O": "output"
  33217. },
  33218. "connections": {
  33219. "I0": [ "0" ],
  33220. "I1": [ 1293 ],
  33221. "I2": [ 1294 ],
  33222. "I3": [ 1258 ],
  33223. "O": [ 1295 ]
  33224. }
  33225. },
  33226. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_20": {
  33227. "hide_name": 0,
  33228. "type": "SB_LUT4",
  33229. "parameters": {
  33230. "LUT_INIT": "1111000011001100"
  33231. },
  33232. "attributes": {
  33233. "module_not_derived": "00000000000000000000000000000001",
  33234. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33235. },
  33236. "port_directions": {
  33237. "I0": "input",
  33238. "I1": "input",
  33239. "I2": "input",
  33240. "I3": "input",
  33241. "O": "output"
  33242. },
  33243. "connections": {
  33244. "I0": [ "0" ],
  33245. "I1": [ 1296 ],
  33246. "I2": [ 1297 ],
  33247. "I3": [ 1258 ],
  33248. "O": [ 1298 ]
  33249. }
  33250. },
  33251. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_21": {
  33252. "hide_name": 0,
  33253. "type": "SB_LUT4",
  33254. "parameters": {
  33255. "LUT_INIT": "1111000011001100"
  33256. },
  33257. "attributes": {
  33258. "module_not_derived": "00000000000000000000000000000001",
  33259. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33260. },
  33261. "port_directions": {
  33262. "I0": "input",
  33263. "I1": "input",
  33264. "I2": "input",
  33265. "I3": "input",
  33266. "O": "output"
  33267. },
  33268. "connections": {
  33269. "I0": [ "0" ],
  33270. "I1": [ 1299 ],
  33271. "I2": [ 1300 ],
  33272. "I3": [ 1258 ],
  33273. "O": [ 1301 ]
  33274. }
  33275. },
  33276. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_22": {
  33277. "hide_name": 0,
  33278. "type": "SB_LUT4",
  33279. "parameters": {
  33280. "LUT_INIT": "1111000011001100"
  33281. },
  33282. "attributes": {
  33283. "module_not_derived": "00000000000000000000000000000001",
  33284. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33285. },
  33286. "port_directions": {
  33287. "I0": "input",
  33288. "I1": "input",
  33289. "I2": "input",
  33290. "I3": "input",
  33291. "O": "output"
  33292. },
  33293. "connections": {
  33294. "I0": [ "0" ],
  33295. "I1": [ 1302 ],
  33296. "I2": [ 1303 ],
  33297. "I3": [ 1258 ],
  33298. "O": [ 1304 ]
  33299. }
  33300. },
  33301. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_23": {
  33302. "hide_name": 0,
  33303. "type": "SB_LUT4",
  33304. "parameters": {
  33305. "LUT_INIT": "1111000011001100"
  33306. },
  33307. "attributes": {
  33308. "module_not_derived": "00000000000000000000000000000001",
  33309. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33310. },
  33311. "port_directions": {
  33312. "I0": "input",
  33313. "I1": "input",
  33314. "I2": "input",
  33315. "I3": "input",
  33316. "O": "output"
  33317. },
  33318. "connections": {
  33319. "I0": [ "0" ],
  33320. "I1": [ 1305 ],
  33321. "I2": [ 1306 ],
  33322. "I3": [ 1258 ],
  33323. "O": [ 1307 ]
  33324. }
  33325. },
  33326. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_24": {
  33327. "hide_name": 0,
  33328. "type": "SB_LUT4",
  33329. "parameters": {
  33330. "LUT_INIT": "1111000011001100"
  33331. },
  33332. "attributes": {
  33333. "module_not_derived": "00000000000000000000000000000001",
  33334. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33335. },
  33336. "port_directions": {
  33337. "I0": "input",
  33338. "I1": "input",
  33339. "I2": "input",
  33340. "I3": "input",
  33341. "O": "output"
  33342. },
  33343. "connections": {
  33344. "I0": [ "0" ],
  33345. "I1": [ 1308 ],
  33346. "I2": [ 1309 ],
  33347. "I3": [ 1258 ],
  33348. "O": [ 1310 ]
  33349. }
  33350. },
  33351. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_25": {
  33352. "hide_name": 0,
  33353. "type": "SB_LUT4",
  33354. "parameters": {
  33355. "LUT_INIT": "1111000011001100"
  33356. },
  33357. "attributes": {
  33358. "module_not_derived": "00000000000000000000000000000001",
  33359. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33360. },
  33361. "port_directions": {
  33362. "I0": "input",
  33363. "I1": "input",
  33364. "I2": "input",
  33365. "I3": "input",
  33366. "O": "output"
  33367. },
  33368. "connections": {
  33369. "I0": [ "0" ],
  33370. "I1": [ 1311 ],
  33371. "I2": [ 1312 ],
  33372. "I3": [ 1258 ],
  33373. "O": [ 1313 ]
  33374. }
  33375. },
  33376. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_26": {
  33377. "hide_name": 0,
  33378. "type": "SB_LUT4",
  33379. "parameters": {
  33380. "LUT_INIT": "1111000011001100"
  33381. },
  33382. "attributes": {
  33383. "module_not_derived": "00000000000000000000000000000001",
  33384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33385. },
  33386. "port_directions": {
  33387. "I0": "input",
  33388. "I1": "input",
  33389. "I2": "input",
  33390. "I3": "input",
  33391. "O": "output"
  33392. },
  33393. "connections": {
  33394. "I0": [ "0" ],
  33395. "I1": [ 1314 ],
  33396. "I2": [ 1315 ],
  33397. "I3": [ 1258 ],
  33398. "O": [ 1316 ]
  33399. }
  33400. },
  33401. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_27": {
  33402. "hide_name": 0,
  33403. "type": "SB_LUT4",
  33404. "parameters": {
  33405. "LUT_INIT": "1111000011001100"
  33406. },
  33407. "attributes": {
  33408. "module_not_derived": "00000000000000000000000000000001",
  33409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33410. },
  33411. "port_directions": {
  33412. "I0": "input",
  33413. "I1": "input",
  33414. "I2": "input",
  33415. "I3": "input",
  33416. "O": "output"
  33417. },
  33418. "connections": {
  33419. "I0": [ "0" ],
  33420. "I1": [ 1317 ],
  33421. "I2": [ 1318 ],
  33422. "I3": [ 1258 ],
  33423. "O": [ 1319 ]
  33424. }
  33425. },
  33426. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_28": {
  33427. "hide_name": 0,
  33428. "type": "SB_LUT4",
  33429. "parameters": {
  33430. "LUT_INIT": "1111000011001100"
  33431. },
  33432. "attributes": {
  33433. "module_not_derived": "00000000000000000000000000000001",
  33434. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33435. },
  33436. "port_directions": {
  33437. "I0": "input",
  33438. "I1": "input",
  33439. "I2": "input",
  33440. "I3": "input",
  33441. "O": "output"
  33442. },
  33443. "connections": {
  33444. "I0": [ "0" ],
  33445. "I1": [ 1320 ],
  33446. "I2": [ 1321 ],
  33447. "I3": [ 1258 ],
  33448. "O": [ 1322 ]
  33449. }
  33450. },
  33451. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_29": {
  33452. "hide_name": 0,
  33453. "type": "SB_LUT4",
  33454. "parameters": {
  33455. "LUT_INIT": "1111000011001100"
  33456. },
  33457. "attributes": {
  33458. "module_not_derived": "00000000000000000000000000000001",
  33459. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33460. },
  33461. "port_directions": {
  33462. "I0": "input",
  33463. "I1": "input",
  33464. "I2": "input",
  33465. "I3": "input",
  33466. "O": "output"
  33467. },
  33468. "connections": {
  33469. "I0": [ "0" ],
  33470. "I1": [ 1323 ],
  33471. "I2": [ 1324 ],
  33472. "I3": [ 1258 ],
  33473. "O": [ 1325 ]
  33474. }
  33475. },
  33476. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_3": {
  33477. "hide_name": 0,
  33478. "type": "SB_LUT4",
  33479. "parameters": {
  33480. "LUT_INIT": "1111000011001100"
  33481. },
  33482. "attributes": {
  33483. "module_not_derived": "00000000000000000000000000000001",
  33484. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33485. },
  33486. "port_directions": {
  33487. "I0": "input",
  33488. "I1": "input",
  33489. "I2": "input",
  33490. "I3": "input",
  33491. "O": "output"
  33492. },
  33493. "connections": {
  33494. "I0": [ "0" ],
  33495. "I1": [ 1326 ],
  33496. "I2": [ 1327 ],
  33497. "I3": [ 1258 ],
  33498. "O": [ 1328 ]
  33499. }
  33500. },
  33501. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_30": {
  33502. "hide_name": 0,
  33503. "type": "SB_LUT4",
  33504. "parameters": {
  33505. "LUT_INIT": "1111000011001100"
  33506. },
  33507. "attributes": {
  33508. "module_not_derived": "00000000000000000000000000000001",
  33509. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33510. },
  33511. "port_directions": {
  33512. "I0": "input",
  33513. "I1": "input",
  33514. "I2": "input",
  33515. "I3": "input",
  33516. "O": "output"
  33517. },
  33518. "connections": {
  33519. "I0": [ "0" ],
  33520. "I1": [ 1329 ],
  33521. "I2": [ 1330 ],
  33522. "I3": [ 1258 ],
  33523. "O": [ 1331 ]
  33524. }
  33525. },
  33526. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_31": {
  33527. "hide_name": 0,
  33528. "type": "SB_LUT4",
  33529. "parameters": {
  33530. "LUT_INIT": "1111110000001100"
  33531. },
  33532. "attributes": {
  33533. "module_not_derived": "00000000000000000000000000000001",
  33534. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33535. },
  33536. "port_directions": {
  33537. "I0": "input",
  33538. "I1": "input",
  33539. "I2": "input",
  33540. "I3": "input",
  33541. "O": "output"
  33542. },
  33543. "connections": {
  33544. "I0": [ "0" ],
  33545. "I1": [ 1332 ],
  33546. "I2": [ 1258 ],
  33547. "I3": [ 1333 ],
  33548. "O": [ 1334 ]
  33549. }
  33550. },
  33551. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_4": {
  33552. "hide_name": 0,
  33553. "type": "SB_LUT4",
  33554. "parameters": {
  33555. "LUT_INIT": "1111000011001100"
  33556. },
  33557. "attributes": {
  33558. "module_not_derived": "00000000000000000000000000000001",
  33559. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33560. },
  33561. "port_directions": {
  33562. "I0": "input",
  33563. "I1": "input",
  33564. "I2": "input",
  33565. "I3": "input",
  33566. "O": "output"
  33567. },
  33568. "connections": {
  33569. "I0": [ "0" ],
  33570. "I1": [ 1335 ],
  33571. "I2": [ 1336 ],
  33572. "I3": [ 1258 ],
  33573. "O": [ 1337 ]
  33574. }
  33575. },
  33576. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_5": {
  33577. "hide_name": 0,
  33578. "type": "SB_LUT4",
  33579. "parameters": {
  33580. "LUT_INIT": "1111000011001100"
  33581. },
  33582. "attributes": {
  33583. "module_not_derived": "00000000000000000000000000000001",
  33584. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33585. },
  33586. "port_directions": {
  33587. "I0": "input",
  33588. "I1": "input",
  33589. "I2": "input",
  33590. "I3": "input",
  33591. "O": "output"
  33592. },
  33593. "connections": {
  33594. "I0": [ "0" ],
  33595. "I1": [ 1338 ],
  33596. "I2": [ 1339 ],
  33597. "I3": [ 1258 ],
  33598. "O": [ 1340 ]
  33599. }
  33600. },
  33601. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_6": {
  33602. "hide_name": 0,
  33603. "type": "SB_LUT4",
  33604. "parameters": {
  33605. "LUT_INIT": "1111000011001100"
  33606. },
  33607. "attributes": {
  33608. "module_not_derived": "00000000000000000000000000000001",
  33609. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33610. },
  33611. "port_directions": {
  33612. "I0": "input",
  33613. "I1": "input",
  33614. "I2": "input",
  33615. "I3": "input",
  33616. "O": "output"
  33617. },
  33618. "connections": {
  33619. "I0": [ "0" ],
  33620. "I1": [ 1341 ],
  33621. "I2": [ 1342 ],
  33622. "I3": [ 1258 ],
  33623. "O": [ 1343 ]
  33624. }
  33625. },
  33626. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_7": {
  33627. "hide_name": 0,
  33628. "type": "SB_LUT4",
  33629. "parameters": {
  33630. "LUT_INIT": "1111000011001100"
  33631. },
  33632. "attributes": {
  33633. "module_not_derived": "00000000000000000000000000000001",
  33634. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33635. },
  33636. "port_directions": {
  33637. "I0": "input",
  33638. "I1": "input",
  33639. "I2": "input",
  33640. "I3": "input",
  33641. "O": "output"
  33642. },
  33643. "connections": {
  33644. "I0": [ "0" ],
  33645. "I1": [ 1344 ],
  33646. "I2": [ 1345 ],
  33647. "I3": [ 1258 ],
  33648. "O": [ 1346 ]
  33649. }
  33650. },
  33651. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_8": {
  33652. "hide_name": 0,
  33653. "type": "SB_LUT4",
  33654. "parameters": {
  33655. "LUT_INIT": "1111000011001100"
  33656. },
  33657. "attributes": {
  33658. "module_not_derived": "00000000000000000000000000000001",
  33659. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33660. },
  33661. "port_directions": {
  33662. "I0": "input",
  33663. "I1": "input",
  33664. "I2": "input",
  33665. "I3": "input",
  33666. "O": "output"
  33667. },
  33668. "connections": {
  33669. "I0": [ "0" ],
  33670. "I1": [ 1347 ],
  33671. "I2": [ 1348 ],
  33672. "I3": [ 1258 ],
  33673. "O": [ 1349 ]
  33674. }
  33675. },
  33676. "cpu_I.IBusCachedPlugin_cache._zz_11__SB_LUT4_O_9": {
  33677. "hide_name": 0,
  33678. "type": "SB_LUT4",
  33679. "parameters": {
  33680. "LUT_INIT": "1111000011001100"
  33681. },
  33682. "attributes": {
  33683. "module_not_derived": "00000000000000000000000000000001",
  33684. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33685. },
  33686. "port_directions": {
  33687. "I0": "input",
  33688. "I1": "input",
  33689. "I2": "input",
  33690. "I3": "input",
  33691. "O": "output"
  33692. },
  33693. "connections": {
  33694. "I0": [ "0" ],
  33695. "I1": [ 1350 ],
  33696. "I2": [ 1351 ],
  33697. "I3": [ 1258 ],
  33698. "O": [ 1352 ]
  33699. }
  33700. },
  33701. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_DFF_Q": {
  33702. "hide_name": 0,
  33703. "type": "SB_DFF",
  33704. "parameters": {
  33705. },
  33706. "attributes": {
  33707. "module_not_derived": "00000000000000000000000000000001",
  33708. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  33709. },
  33710. "port_directions": {
  33711. "C": "input",
  33712. "D": "input",
  33713. "Q": "output"
  33714. },
  33715. "connections": {
  33716. "C": [ 42 ],
  33717. "D": [ 1353 ],
  33718. "Q": [ 1354 ]
  33719. }
  33720. },
  33721. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0": {
  33722. "hide_name": 0,
  33723. "type": "SB_LUT4",
  33724. "parameters": {
  33725. "LUT_INIT": "0000000000001000"
  33726. },
  33727. "attributes": {
  33728. "module_not_derived": "00000000000000000000000000000001",
  33729. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33730. },
  33731. "port_directions": {
  33732. "I0": "input",
  33733. "I1": "input",
  33734. "I2": "input",
  33735. "I3": "input",
  33736. "O": "output"
  33737. },
  33738. "connections": {
  33739. "I0": [ 1354 ],
  33740. "I1": [ 1353 ],
  33741. "I2": [ 1008 ],
  33742. "I3": [ 1022 ],
  33743. "O": [ 1355 ]
  33744. }
  33745. },
  33746. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFR_Q": {
  33747. "hide_name": 0,
  33748. "type": "SB_DFFR",
  33749. "parameters": {
  33750. },
  33751. "attributes": {
  33752. "module_not_derived": "00000000000000000000000000000001",
  33753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  33754. },
  33755. "port_directions": {
  33756. "C": "input",
  33757. "D": "input",
  33758. "Q": "output",
  33759. "R": "input"
  33760. },
  33761. "connections": {
  33762. "C": [ 42 ],
  33763. "D": [ "1" ],
  33764. "Q": [ 1356 ],
  33765. "R": [ 127 ]
  33766. }
  33767. },
  33768. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFS_Q": {
  33769. "hide_name": 0,
  33770. "type": "SB_DFFS",
  33771. "parameters": {
  33772. },
  33773. "attributes": {
  33774. "module_not_derived": "00000000000000000000000000000001",
  33775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:264.3-300.6|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  33776. },
  33777. "port_directions": {
  33778. "C": "input",
  33779. "D": "input",
  33780. "Q": "output",
  33781. "S": "input"
  33782. },
  33783. "connections": {
  33784. "C": [ 42 ],
  33785. "D": [ 1357 ],
  33786. "Q": [ 1358 ],
  33787. "S": [ 127 ]
  33788. }
  33789. },
  33790. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFS_Q_D_SB_LUT4_O": {
  33791. "hide_name": 0,
  33792. "type": "SB_LUT4",
  33793. "parameters": {
  33794. "LUT_INIT": "0000111100001100"
  33795. },
  33796. "attributes": {
  33797. "module_not_derived": "00000000000000000000000000000001",
  33798. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33799. },
  33800. "port_directions": {
  33801. "I0": "input",
  33802. "I1": "input",
  33803. "I2": "input",
  33804. "I3": "input",
  33805. "O": "output"
  33806. },
  33807. "connections": {
  33808. "I0": [ "0" ],
  33809. "I1": [ 1358 ],
  33810. "I2": [ 1359 ],
  33811. "I3": [ 1360 ],
  33812. "O": [ 1357 ]
  33813. }
  33814. },
  33815. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFS_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  33816. "hide_name": 0,
  33817. "type": "SB_LUT4",
  33818. "parameters": {
  33819. "LUT_INIT": "0000001000000000"
  33820. },
  33821. "attributes": {
  33822. "module_not_derived": "00000000000000000000000000000001",
  33823. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33824. },
  33825. "port_directions": {
  33826. "I0": "input",
  33827. "I1": "input",
  33828. "I2": "input",
  33829. "I3": "input",
  33830. "O": "output"
  33831. },
  33832. "connections": {
  33833. "I0": [ 1356 ],
  33834. "I1": [ 1358 ],
  33835. "I2": [ 842 ],
  33836. "I3": [ 1355 ],
  33837. "O": [ 1361 ]
  33838. }
  33839. },
  33840. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_1": {
  33841. "hide_name": 0,
  33842. "type": "SB_LUT4",
  33843. "parameters": {
  33844. "LUT_INIT": "0010000000000000"
  33845. },
  33846. "attributes": {
  33847. "module_not_derived": "00000000000000000000000000000001",
  33848. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33849. },
  33850. "port_directions": {
  33851. "I0": "input",
  33852. "I1": "input",
  33853. "I2": "input",
  33854. "I3": "input",
  33855. "O": "output"
  33856. },
  33857. "connections": {
  33858. "I0": [ 1362 ],
  33859. "I1": [ 1363 ],
  33860. "I2": [ 1364 ],
  33861. "I3": [ 1365 ],
  33862. "O": [ 1360 ]
  33863. }
  33864. },
  33865. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O": {
  33866. "hide_name": 0,
  33867. "type": "SB_LUT4",
  33868. "parameters": {
  33869. "LUT_INIT": "1100000011111111"
  33870. },
  33871. "attributes": {
  33872. "module_not_derived": "00000000000000000000000000000001",
  33873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33874. },
  33875. "port_directions": {
  33876. "I0": "input",
  33877. "I1": "input",
  33878. "I2": "input",
  33879. "I3": "input",
  33880. "O": "output"
  33881. },
  33882. "connections": {
  33883. "I0": [ "0" ],
  33884. "I1": [ 1366 ],
  33885. "I2": [ 1367 ],
  33886. "I3": [ 1368 ],
  33887. "O": [ 1369 ]
  33888. }
  33889. },
  33890. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1": {
  33891. "hide_name": 0,
  33892. "type": "SB_LUT4",
  33893. "parameters": {
  33894. "LUT_INIT": "1100000011111111"
  33895. },
  33896. "attributes": {
  33897. "module_not_derived": "00000000000000000000000000000001",
  33898. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  33899. },
  33900. "port_directions": {
  33901. "I0": "input",
  33902. "I1": "input",
  33903. "I2": "input",
  33904. "I3": "input",
  33905. "O": "output"
  33906. },
  33907. "connections": {
  33908. "I0": [ "0" ],
  33909. "I1": [ 1370 ],
  33910. "I2": [ 1367 ],
  33911. "I3": [ 1371 ],
  33912. "O": [ 1372 ]
  33913. }
  33914. },
  33915. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O": {
  33916. "hide_name": 0,
  33917. "type": "SB_LUT4",
  33918. "parameters": {
  33919. "LUT_INIT": "0000000001001100"
  33920. },
  33921. "attributes": {
  33922. "module_not_derived": "00000000000000000000000000000001",
  33923. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33924. },
  33925. "port_directions": {
  33926. "I0": "input",
  33927. "I1": "input",
  33928. "I2": "input",
  33929. "I3": "input",
  33930. "O": "output"
  33931. },
  33932. "connections": {
  33933. "I0": [ 1373 ],
  33934. "I1": [ 1374 ],
  33935. "I2": [ 1375 ],
  33936. "I3": [ 1376 ],
  33937. "O": [ 1371 ]
  33938. }
  33939. },
  33940. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  33941. "hide_name": 0,
  33942. "type": "SB_LUT4",
  33943. "parameters": {
  33944. "LUT_INIT": "0011111100110101"
  33945. },
  33946. "attributes": {
  33947. "module_not_derived": "00000000000000000000000000000001",
  33948. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33949. },
  33950. "port_directions": {
  33951. "I0": "input",
  33952. "I1": "input",
  33953. "I2": "input",
  33954. "I3": "input",
  33955. "O": "output"
  33956. },
  33957. "connections": {
  33958. "I0": [ 1212 ],
  33959. "I1": [ 1094 ],
  33960. "I2": [ 1050 ],
  33961. "I3": [ 1052 ],
  33962. "O": [ 1374 ]
  33963. }
  33964. },
  33965. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  33966. "hide_name": 0,
  33967. "type": "SB_LUT4",
  33968. "parameters": {
  33969. "LUT_INIT": "1011100000000000"
  33970. },
  33971. "attributes": {
  33972. "module_not_derived": "00000000000000000000000000000001",
  33973. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33974. },
  33975. "port_directions": {
  33976. "I0": "input",
  33977. "I1": "input",
  33978. "I2": "input",
  33979. "I3": "input",
  33980. "O": "output"
  33981. },
  33982. "connections": {
  33983. "I0": [ 1377 ],
  33984. "I1": [ 1378 ],
  33985. "I2": [ 1379 ],
  33986. "I3": [ 1380 ],
  33987. "O": [ 1376 ]
  33988. }
  33989. },
  33990. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O": {
  33991. "hide_name": 0,
  33992. "type": "SB_LUT4",
  33993. "parameters": {
  33994. "LUT_INIT": "0110100110010110"
  33995. },
  33996. "attributes": {
  33997. "module_not_derived": "00000000000000000000000000000001",
  33998. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  33999. },
  34000. "port_directions": {
  34001. "I0": "input",
  34002. "I1": "input",
  34003. "I2": "input",
  34004. "I3": "input",
  34005. "O": "output"
  34006. },
  34007. "connections": {
  34008. "I0": [ "0" ],
  34009. "I1": [ "0" ],
  34010. "I2": [ 1381 ],
  34011. "I3": [ 1382 ],
  34012. "O": [ 1379 ]
  34013. }
  34014. },
  34015. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  34016. "hide_name": 0,
  34017. "type": "SB_CARRY",
  34018. "parameters": {
  34019. },
  34020. "attributes": {
  34021. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34022. },
  34023. "port_directions": {
  34024. "CI": "input",
  34025. "CO": "output",
  34026. "I0": "input",
  34027. "I1": "input"
  34028. },
  34029. "connections": {
  34030. "CI": [ 1383 ],
  34031. "CO": [ 1382 ],
  34032. "I0": [ "0" ],
  34033. "I1": [ 1384 ]
  34034. }
  34035. },
  34036. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2": {
  34037. "hide_name": 0,
  34038. "type": "SB_LUT4",
  34039. "parameters": {
  34040. "LUT_INIT": "1100000011111111"
  34041. },
  34042. "attributes": {
  34043. "module_not_derived": "00000000000000000000000000000001",
  34044. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34045. },
  34046. "port_directions": {
  34047. "I0": "input",
  34048. "I1": "input",
  34049. "I2": "input",
  34050. "I3": "input",
  34051. "O": "output"
  34052. },
  34053. "connections": {
  34054. "I0": [ "0" ],
  34055. "I1": [ 1385 ],
  34056. "I2": [ 1367 ],
  34057. "I3": [ 1386 ],
  34058. "O": [ 1387 ]
  34059. }
  34060. },
  34061. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O": {
  34062. "hide_name": 0,
  34063. "type": "SB_LUT4",
  34064. "parameters": {
  34065. "LUT_INIT": "0011111100000000"
  34066. },
  34067. "attributes": {
  34068. "module_not_derived": "00000000000000000000000000000001",
  34069. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34070. },
  34071. "port_directions": {
  34072. "I0": "input",
  34073. "I1": "input",
  34074. "I2": "input",
  34075. "I3": "input",
  34076. "O": "output"
  34077. },
  34078. "connections": {
  34079. "I0": [ "0" ],
  34080. "I1": [ 1388 ],
  34081. "I2": [ 1380 ],
  34082. "I3": [ 1389 ],
  34083. "O": [ 1386 ]
  34084. }
  34085. },
  34086. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  34087. "hide_name": 0,
  34088. "type": "SB_LUT4",
  34089. "parameters": {
  34090. "LUT_INIT": "0000111100000111"
  34091. },
  34092. "attributes": {
  34093. "module_not_derived": "00000000000000000000000000000001",
  34094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34095. },
  34096. "port_directions": {
  34097. "I0": "input",
  34098. "I1": "input",
  34099. "I2": "input",
  34100. "I3": "input",
  34101. "O": "output"
  34102. },
  34103. "connections": {
  34104. "I0": [ 1390 ],
  34105. "I1": [ 1391 ],
  34106. "I2": [ 1392 ],
  34107. "I3": [ 1393 ],
  34108. "O": [ 1389 ]
  34109. }
  34110. },
  34111. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  34112. "hide_name": 0,
  34113. "type": "SB_LUT4",
  34114. "parameters": {
  34115. "LUT_INIT": "1100111111000000"
  34116. },
  34117. "attributes": {
  34118. "module_not_derived": "00000000000000000000000000000001",
  34119. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34120. },
  34121. "port_directions": {
  34122. "I0": "input",
  34123. "I1": "input",
  34124. "I2": "input",
  34125. "I3": "input",
  34126. "O": "output"
  34127. },
  34128. "connections": {
  34129. "I0": [ "0" ],
  34130. "I1": [ 1394 ],
  34131. "I2": [ 1378 ],
  34132. "I3": [ 1395 ],
  34133. "O": [ 1388 ]
  34134. }
  34135. },
  34136. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  34137. "hide_name": 0,
  34138. "type": "SB_LUT4",
  34139. "parameters": {
  34140. "LUT_INIT": "0110100110010110"
  34141. },
  34142. "attributes": {
  34143. "module_not_derived": "00000000000000000000000000000001",
  34144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34145. },
  34146. "port_directions": {
  34147. "I0": "input",
  34148. "I1": "input",
  34149. "I2": "input",
  34150. "I3": "input",
  34151. "O": "output"
  34152. },
  34153. "connections": {
  34154. "I0": [ "0" ],
  34155. "I1": [ "0" ],
  34156. "I2": [ 1384 ],
  34157. "I3": [ 1383 ],
  34158. "O": [ 1395 ]
  34159. }
  34160. },
  34161. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  34162. "hide_name": 0,
  34163. "type": "SB_CARRY",
  34164. "parameters": {
  34165. },
  34166. "attributes": {
  34167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34168. },
  34169. "port_directions": {
  34170. "CI": "input",
  34171. "CO": "output",
  34172. "I0": "input",
  34173. "I1": "input"
  34174. },
  34175. "connections": {
  34176. "CI": [ 1396 ],
  34177. "CO": [ 1383 ],
  34178. "I0": [ "0" ],
  34179. "I1": [ 1397 ]
  34180. }
  34181. },
  34182. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  34183. "hide_name": 0,
  34184. "type": "SB_LUT4",
  34185. "parameters": {
  34186. "LUT_INIT": "1100000011001010"
  34187. },
  34188. "attributes": {
  34189. "module_not_derived": "00000000000000000000000000000001",
  34190. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34191. },
  34192. "port_directions": {
  34193. "I0": "input",
  34194. "I1": "input",
  34195. "I2": "input",
  34196. "I3": "input",
  34197. "O": "output"
  34198. },
  34199. "connections": {
  34200. "I0": [ 1214 ],
  34201. "I1": [ 1096 ],
  34202. "I2": [ 1050 ],
  34203. "I3": [ 1052 ],
  34204. "O": [ 1392 ]
  34205. }
  34206. },
  34207. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3": {
  34208. "hide_name": 0,
  34209. "type": "SB_LUT4",
  34210. "parameters": {
  34211. "LUT_INIT": "1100000011111111"
  34212. },
  34213. "attributes": {
  34214. "module_not_derived": "00000000000000000000000000000001",
  34215. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34216. },
  34217. "port_directions": {
  34218. "I0": "input",
  34219. "I1": "input",
  34220. "I2": "input",
  34221. "I3": "input",
  34222. "O": "output"
  34223. },
  34224. "connections": {
  34225. "I0": [ "0" ],
  34226. "I1": [ 1398 ],
  34227. "I2": [ 1367 ],
  34228. "I3": [ 1399 ],
  34229. "O": [ 1400 ]
  34230. }
  34231. },
  34232. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O": {
  34233. "hide_name": 0,
  34234. "type": "SB_LUT4",
  34235. "parameters": {
  34236. "LUT_INIT": "0000000001001100"
  34237. },
  34238. "attributes": {
  34239. "module_not_derived": "00000000000000000000000000000001",
  34240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34241. },
  34242. "port_directions": {
  34243. "I0": "input",
  34244. "I1": "input",
  34245. "I2": "input",
  34246. "I3": "input",
  34247. "O": "output"
  34248. },
  34249. "connections": {
  34250. "I0": [ 1401 ],
  34251. "I1": [ 1402 ],
  34252. "I2": [ 1375 ],
  34253. "I3": [ 1403 ],
  34254. "O": [ 1399 ]
  34255. }
  34256. },
  34257. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  34258. "hide_name": 0,
  34259. "type": "SB_LUT4",
  34260. "parameters": {
  34261. "LUT_INIT": "0011111100110101"
  34262. },
  34263. "attributes": {
  34264. "module_not_derived": "00000000000000000000000000000001",
  34265. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34266. },
  34267. "port_directions": {
  34268. "I0": "input",
  34269. "I1": "input",
  34270. "I2": "input",
  34271. "I3": "input",
  34272. "O": "output"
  34273. },
  34274. "connections": {
  34275. "I0": [ 1215 ],
  34276. "I1": [ 1098 ],
  34277. "I2": [ 1050 ],
  34278. "I3": [ 1052 ],
  34279. "O": [ 1402 ]
  34280. }
  34281. },
  34282. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  34283. "hide_name": 0,
  34284. "type": "SB_LUT4",
  34285. "parameters": {
  34286. "LUT_INIT": "1011100000000000"
  34287. },
  34288. "attributes": {
  34289. "module_not_derived": "00000000000000000000000000000001",
  34290. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34291. },
  34292. "port_directions": {
  34293. "I0": "input",
  34294. "I1": "input",
  34295. "I2": "input",
  34296. "I3": "input",
  34297. "O": "output"
  34298. },
  34299. "connections": {
  34300. "I0": [ 1404 ],
  34301. "I1": [ 1378 ],
  34302. "I2": [ 1405 ],
  34303. "I3": [ 1380 ],
  34304. "O": [ 1403 ]
  34305. }
  34306. },
  34307. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O": {
  34308. "hide_name": 0,
  34309. "type": "SB_LUT4",
  34310. "parameters": {
  34311. "LUT_INIT": "0110100110010110"
  34312. },
  34313. "attributes": {
  34314. "module_not_derived": "00000000000000000000000000000001",
  34315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34316. },
  34317. "port_directions": {
  34318. "I0": "input",
  34319. "I1": "input",
  34320. "I2": "input",
  34321. "I3": "input",
  34322. "O": "output"
  34323. },
  34324. "connections": {
  34325. "I0": [ "0" ],
  34326. "I1": [ "0" ],
  34327. "I2": [ 1397 ],
  34328. "I3": [ 1396 ],
  34329. "O": [ 1405 ]
  34330. }
  34331. },
  34332. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  34333. "hide_name": 0,
  34334. "type": "SB_CARRY",
  34335. "parameters": {
  34336. },
  34337. "attributes": {
  34338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34339. },
  34340. "port_directions": {
  34341. "CI": "input",
  34342. "CO": "output",
  34343. "I0": "input",
  34344. "I1": "input"
  34345. },
  34346. "connections": {
  34347. "CI": [ 1406 ],
  34348. "CO": [ 1396 ],
  34349. "I0": [ "0" ],
  34350. "I1": [ 1407 ]
  34351. }
  34352. },
  34353. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4": {
  34354. "hide_name": 0,
  34355. "type": "SB_LUT4",
  34356. "parameters": {
  34357. "LUT_INIT": "1100000011111111"
  34358. },
  34359. "attributes": {
  34360. "module_not_derived": "00000000000000000000000000000001",
  34361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34362. },
  34363. "port_directions": {
  34364. "I0": "input",
  34365. "I1": "input",
  34366. "I2": "input",
  34367. "I3": "input",
  34368. "O": "output"
  34369. },
  34370. "connections": {
  34371. "I0": [ "0" ],
  34372. "I1": [ 1408 ],
  34373. "I2": [ 1367 ],
  34374. "I3": [ 1409 ],
  34375. "O": [ 1410 ]
  34376. }
  34377. },
  34378. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O": {
  34379. "hide_name": 0,
  34380. "type": "SB_LUT4",
  34381. "parameters": {
  34382. "LUT_INIT": "0000000000010011"
  34383. },
  34384. "attributes": {
  34385. "module_not_derived": "00000000000000000000000000000001",
  34386. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34387. },
  34388. "port_directions": {
  34389. "I0": "input",
  34390. "I1": "input",
  34391. "I2": "input",
  34392. "I3": "input",
  34393. "O": "output"
  34394. },
  34395. "connections": {
  34396. "I0": [ 1411 ],
  34397. "I1": [ 1412 ],
  34398. "I2": [ 1375 ],
  34399. "I3": [ 1413 ],
  34400. "O": [ 1409 ]
  34401. }
  34402. },
  34403. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  34404. "hide_name": 0,
  34405. "type": "SB_LUT4",
  34406. "parameters": {
  34407. "LUT_INIT": "1100000011001010"
  34408. },
  34409. "attributes": {
  34410. "module_not_derived": "00000000000000000000000000000001",
  34411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34412. },
  34413. "port_directions": {
  34414. "I0": "input",
  34415. "I1": "input",
  34416. "I2": "input",
  34417. "I3": "input",
  34418. "O": "output"
  34419. },
  34420. "connections": {
  34421. "I0": [ 1217 ],
  34422. "I1": [ 1100 ],
  34423. "I2": [ 1050 ],
  34424. "I3": [ 1052 ],
  34425. "O": [ 1412 ]
  34426. }
  34427. },
  34428. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  34429. "hide_name": 0,
  34430. "type": "SB_LUT4",
  34431. "parameters": {
  34432. "LUT_INIT": "1011100000000000"
  34433. },
  34434. "attributes": {
  34435. "module_not_derived": "00000000000000000000000000000001",
  34436. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34437. },
  34438. "port_directions": {
  34439. "I0": "input",
  34440. "I1": "input",
  34441. "I2": "input",
  34442. "I3": "input",
  34443. "O": "output"
  34444. },
  34445. "connections": {
  34446. "I0": [ 1414 ],
  34447. "I1": [ 1378 ],
  34448. "I2": [ 1415 ],
  34449. "I3": [ 1380 ],
  34450. "O": [ 1413 ]
  34451. }
  34452. },
  34453. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O": {
  34454. "hide_name": 0,
  34455. "type": "SB_LUT4",
  34456. "parameters": {
  34457. "LUT_INIT": "0110100110010110"
  34458. },
  34459. "attributes": {
  34460. "module_not_derived": "00000000000000000000000000000001",
  34461. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34462. },
  34463. "port_directions": {
  34464. "I0": "input",
  34465. "I1": "input",
  34466. "I2": "input",
  34467. "I3": "input",
  34468. "O": "output"
  34469. },
  34470. "connections": {
  34471. "I0": [ "0" ],
  34472. "I1": [ "0" ],
  34473. "I2": [ 1407 ],
  34474. "I3": [ 1406 ],
  34475. "O": [ 1415 ]
  34476. }
  34477. },
  34478. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5": {
  34479. "hide_name": 0,
  34480. "type": "SB_LUT4",
  34481. "parameters": {
  34482. "LUT_INIT": "1111100011111111"
  34483. },
  34484. "attributes": {
  34485. "module_not_derived": "00000000000000000000000000000001",
  34486. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34487. },
  34488. "port_directions": {
  34489. "I0": "input",
  34490. "I1": "input",
  34491. "I2": "input",
  34492. "I3": "input",
  34493. "O": "output"
  34494. },
  34495. "connections": {
  34496. "I0": [ 1416 ],
  34497. "I1": [ 1367 ],
  34498. "I2": [ 1417 ],
  34499. "I3": [ 1418 ],
  34500. "O": [ 1419 ]
  34501. }
  34502. },
  34503. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O": {
  34504. "hide_name": 0,
  34505. "type": "SB_LUT4",
  34506. "parameters": {
  34507. "LUT_INIT": "0011000011110000"
  34508. },
  34509. "attributes": {
  34510. "module_not_derived": "00000000000000000000000000000001",
  34511. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34512. },
  34513. "port_directions": {
  34514. "I0": "input",
  34515. "I1": "input",
  34516. "I2": "input",
  34517. "I3": "input",
  34518. "O": "output"
  34519. },
  34520. "connections": {
  34521. "I0": [ "0" ],
  34522. "I1": [ 1420 ],
  34523. "I2": [ 1421 ],
  34524. "I3": [ 1375 ],
  34525. "O": [ 1418 ]
  34526. }
  34527. },
  34528. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  34529. "hide_name": 0,
  34530. "type": "SB_LUT4",
  34531. "parameters": {
  34532. "LUT_INIT": "1011100000000000"
  34533. },
  34534. "attributes": {
  34535. "module_not_derived": "00000000000000000000000000000001",
  34536. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34537. },
  34538. "port_directions": {
  34539. "I0": "input",
  34540. "I1": "input",
  34541. "I2": "input",
  34542. "I3": "input",
  34543. "O": "output"
  34544. },
  34545. "connections": {
  34546. "I0": [ 1422 ],
  34547. "I1": [ 1378 ],
  34548. "I2": [ 1423 ],
  34549. "I3": [ 1380 ],
  34550. "O": [ 1417 ]
  34551. }
  34552. },
  34553. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  34554. "hide_name": 0,
  34555. "type": "SB_LUT4",
  34556. "parameters": {
  34557. "LUT_INIT": "0110100110010110"
  34558. },
  34559. "attributes": {
  34560. "module_not_derived": "00000000000000000000000000000001",
  34561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34562. },
  34563. "port_directions": {
  34564. "I0": "input",
  34565. "I1": "input",
  34566. "I2": "input",
  34567. "I3": "input",
  34568. "O": "output"
  34569. },
  34570. "connections": {
  34571. "I0": [ "0" ],
  34572. "I1": [ "0" ],
  34573. "I2": [ 1424 ],
  34574. "I3": [ 1425 ],
  34575. "O": [ 1423 ]
  34576. }
  34577. },
  34578. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CI": {
  34579. "hide_name": 0,
  34580. "type": "SB_CARRY",
  34581. "parameters": {
  34582. },
  34583. "attributes": {
  34584. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34585. },
  34586. "port_directions": {
  34587. "CI": "input",
  34588. "CO": "output",
  34589. "I0": "input",
  34590. "I1": "input"
  34591. },
  34592. "connections": {
  34593. "CI": [ 1425 ],
  34594. "CO": [ 1406 ],
  34595. "I0": [ "0" ],
  34596. "I1": [ 1424 ]
  34597. }
  34598. },
  34599. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  34600. "hide_name": 0,
  34601. "type": "SB_CARRY",
  34602. "parameters": {
  34603. },
  34604. "attributes": {
  34605. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34606. },
  34607. "port_directions": {
  34608. "CI": "input",
  34609. "CO": "output",
  34610. "I0": "input",
  34611. "I1": "input"
  34612. },
  34613. "connections": {
  34614. "CI": [ 1426 ],
  34615. "CO": [ 1425 ],
  34616. "I0": [ "0" ],
  34617. "I1": [ 1427 ]
  34618. }
  34619. },
  34620. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  34621. "hide_name": 0,
  34622. "type": "SB_LUT4",
  34623. "parameters": {
  34624. "LUT_INIT": "0011111100110101"
  34625. },
  34626. "attributes": {
  34627. "module_not_derived": "00000000000000000000000000000001",
  34628. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34629. },
  34630. "port_directions": {
  34631. "I0": "input",
  34632. "I1": "input",
  34633. "I2": "input",
  34634. "I3": "input",
  34635. "O": "output"
  34636. },
  34637. "connections": {
  34638. "I0": [ 1219 ],
  34639. "I1": [ 1102 ],
  34640. "I2": [ 1050 ],
  34641. "I3": [ 1052 ],
  34642. "O": [ 1421 ]
  34643. }
  34644. },
  34645. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O": {
  34646. "hide_name": 0,
  34647. "type": "SB_LUT4",
  34648. "parameters": {
  34649. "LUT_INIT": "0011111100000000"
  34650. },
  34651. "attributes": {
  34652. "module_not_derived": "00000000000000000000000000000001",
  34653. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34654. },
  34655. "port_directions": {
  34656. "I0": "input",
  34657. "I1": "input",
  34658. "I2": "input",
  34659. "I3": "input",
  34660. "O": "output"
  34661. },
  34662. "connections": {
  34663. "I0": [ "0" ],
  34664. "I1": [ 1428 ],
  34665. "I2": [ 1380 ],
  34666. "I3": [ 1429 ],
  34667. "O": [ 1368 ]
  34668. }
  34669. },
  34670. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  34671. "hide_name": 0,
  34672. "type": "SB_LUT4",
  34673. "parameters": {
  34674. "LUT_INIT": "1111000001110000"
  34675. },
  34676. "attributes": {
  34677. "module_not_derived": "00000000000000000000000000000001",
  34678. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34679. },
  34680. "port_directions": {
  34681. "I0": "input",
  34682. "I1": "input",
  34683. "I2": "input",
  34684. "I3": "input",
  34685. "O": "output"
  34686. },
  34687. "connections": {
  34688. "I0": [ 1430 ],
  34689. "I1": [ 1391 ],
  34690. "I2": [ 1431 ],
  34691. "I3": [ 1393 ],
  34692. "O": [ 1429 ]
  34693. }
  34694. },
  34695. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  34696. "hide_name": 0,
  34697. "type": "SB_LUT4",
  34698. "parameters": {
  34699. "LUT_INIT": "1100111111000000"
  34700. },
  34701. "attributes": {
  34702. "module_not_derived": "00000000000000000000000000000001",
  34703. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  34704. },
  34705. "port_directions": {
  34706. "I0": "input",
  34707. "I1": "input",
  34708. "I2": "input",
  34709. "I3": "input",
  34710. "O": "output"
  34711. },
  34712. "connections": {
  34713. "I0": [ "0" ],
  34714. "I1": [ 1432 ],
  34715. "I2": [ 1378 ],
  34716. "I3": [ 1433 ],
  34717. "O": [ 1428 ]
  34718. }
  34719. },
  34720. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  34721. "hide_name": 0,
  34722. "type": "SB_LUT4",
  34723. "parameters": {
  34724. "LUT_INIT": "0110100110010110"
  34725. },
  34726. "attributes": {
  34727. "module_not_derived": "00000000000000000000000000000001",
  34728. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34729. },
  34730. "port_directions": {
  34731. "I0": "input",
  34732. "I1": "input",
  34733. "I2": "input",
  34734. "I3": "input",
  34735. "O": "output"
  34736. },
  34737. "connections": {
  34738. "I0": [ "0" ],
  34739. "I1": [ "0" ],
  34740. "I2": [ 1434 ],
  34741. "I3": [ 1435 ],
  34742. "O": [ 1433 ]
  34743. }
  34744. },
  34745. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  34746. "hide_name": 0,
  34747. "type": "SB_CARRY",
  34748. "parameters": {
  34749. },
  34750. "attributes": {
  34751. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34752. },
  34753. "port_directions": {
  34754. "CI": "input",
  34755. "CO": "output",
  34756. "I0": "input",
  34757. "I1": "input"
  34758. },
  34759. "connections": {
  34760. "CI": [ 1382 ],
  34761. "CO": [ 1435 ],
  34762. "I0": [ "0" ],
  34763. "I1": [ 1381 ]
  34764. }
  34765. },
  34766. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  34767. "hide_name": 0,
  34768. "type": "SB_LUT4",
  34769. "parameters": {
  34770. "LUT_INIT": "0011111100110101"
  34771. },
  34772. "attributes": {
  34773. "module_not_derived": "00000000000000000000000000000001",
  34774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34775. },
  34776. "port_directions": {
  34777. "I0": "input",
  34778. "I1": "input",
  34779. "I2": "input",
  34780. "I3": "input",
  34781. "O": "output"
  34782. },
  34783. "connections": {
  34784. "I0": [ 1210 ],
  34785. "I1": [ 1092 ],
  34786. "I2": [ 1050 ],
  34787. "I3": [ 1052 ],
  34788. "O": [ 1431 ]
  34789. }
  34790. },
  34791. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O": {
  34792. "hide_name": 0,
  34793. "type": "SB_LUT4",
  34794. "parameters": {
  34795. "LUT_INIT": "1111100011111111"
  34796. },
  34797. "attributes": {
  34798. "module_not_derived": "00000000000000000000000000000001",
  34799. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34800. },
  34801. "port_directions": {
  34802. "I0": "input",
  34803. "I1": "input",
  34804. "I2": "input",
  34805. "I3": "input",
  34806. "O": "output"
  34807. },
  34808. "connections": {
  34809. "I0": [ 1436 ],
  34810. "I1": [ 1367 ],
  34811. "I2": [ 1437 ],
  34812. "I3": [ 1438 ],
  34813. "O": [ 1439 ]
  34814. }
  34815. },
  34816. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1": {
  34817. "hide_name": 0,
  34818. "type": "SB_LUT4",
  34819. "parameters": {
  34820. "LUT_INIT": "1111111110110011"
  34821. },
  34822. "attributes": {
  34823. "module_not_derived": "00000000000000000000000000000001",
  34824. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34825. },
  34826. "port_directions": {
  34827. "I0": "input",
  34828. "I1": "input",
  34829. "I2": "input",
  34830. "I3": "input",
  34831. "O": "output"
  34832. },
  34833. "connections": {
  34834. "I0": [ 1440 ],
  34835. "I1": [ 1441 ],
  34836. "I2": [ 1367 ],
  34837. "I3": [ 1442 ],
  34838. "O": [ 1443 ]
  34839. }
  34840. },
  34841. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O": {
  34842. "hide_name": 0,
  34843. "type": "SB_LUT4",
  34844. "parameters": {
  34845. "LUT_INIT": "0000111100000111"
  34846. },
  34847. "attributes": {
  34848. "module_not_derived": "00000000000000000000000000000001",
  34849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34850. },
  34851. "port_directions": {
  34852. "I0": "input",
  34853. "I1": "input",
  34854. "I2": "input",
  34855. "I3": "input",
  34856. "O": "output"
  34857. },
  34858. "connections": {
  34859. "I0": [ 1444 ],
  34860. "I1": [ 1391 ],
  34861. "I2": [ 1445 ],
  34862. "I3": [ 1393 ],
  34863. "O": [ 1441 ]
  34864. }
  34865. },
  34866. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_1": {
  34867. "hide_name": 0,
  34868. "type": "SB_LUT4",
  34869. "parameters": {
  34870. "LUT_INIT": "1011100000000000"
  34871. },
  34872. "attributes": {
  34873. "module_not_derived": "00000000000000000000000000000001",
  34874. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34875. },
  34876. "port_directions": {
  34877. "I0": "input",
  34878. "I1": "input",
  34879. "I2": "input",
  34880. "I3": "input",
  34881. "O": "output"
  34882. },
  34883. "connections": {
  34884. "I0": [ 1446 ],
  34885. "I1": [ 1378 ],
  34886. "I2": [ 1447 ],
  34887. "I3": [ 1380 ],
  34888. "O": [ 1442 ]
  34889. }
  34890. },
  34891. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_1_I2_SB_LUT4_O": {
  34892. "hide_name": 0,
  34893. "type": "SB_LUT4",
  34894. "parameters": {
  34895. "LUT_INIT": "0110100110010110"
  34896. },
  34897. "attributes": {
  34898. "module_not_derived": "00000000000000000000000000000001",
  34899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34900. },
  34901. "port_directions": {
  34902. "I0": "input",
  34903. "I1": "input",
  34904. "I2": "input",
  34905. "I3": "input",
  34906. "O": "output"
  34907. },
  34908. "connections": {
  34909. "I0": [ "0" ],
  34910. "I1": [ "0" ],
  34911. "I2": [ 1427 ],
  34912. "I3": [ 1426 ],
  34913. "O": [ 1447 ]
  34914. }
  34915. },
  34916. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  34917. "hide_name": 0,
  34918. "type": "SB_CARRY",
  34919. "parameters": {
  34920. },
  34921. "attributes": {
  34922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  34923. },
  34924. "port_directions": {
  34925. "CI": "input",
  34926. "CO": "output",
  34927. "I0": "input",
  34928. "I1": "input"
  34929. },
  34930. "connections": {
  34931. "CI": [ 1448 ],
  34932. "CO": [ 1426 ],
  34933. "I0": [ "0" ],
  34934. "I1": [ 1449 ]
  34935. }
  34936. },
  34937. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  34938. "hide_name": 0,
  34939. "type": "SB_LUT4",
  34940. "parameters": {
  34941. "LUT_INIT": "1100000011001010"
  34942. },
  34943. "attributes": {
  34944. "module_not_derived": "00000000000000000000000000000001",
  34945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34946. },
  34947. "port_directions": {
  34948. "I0": "input",
  34949. "I1": "input",
  34950. "I2": "input",
  34951. "I3": "input",
  34952. "O": "output"
  34953. },
  34954. "connections": {
  34955. "I0": [ 1221 ],
  34956. "I1": [ 1104 ],
  34957. "I2": [ 1050 ],
  34958. "I3": [ 1052 ],
  34959. "O": [ 1445 ]
  34960. }
  34961. },
  34962. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I3_SB_LUT4_I3": {
  34963. "hide_name": 0,
  34964. "type": "SB_LUT4",
  34965. "parameters": {
  34966. "LUT_INIT": "0000000011110000"
  34967. },
  34968. "attributes": {
  34969. "module_not_derived": "00000000000000000000000000000001",
  34970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  34971. },
  34972. "port_directions": {
  34973. "I0": "input",
  34974. "I1": "input",
  34975. "I2": "input",
  34976. "I3": "input",
  34977. "O": "output"
  34978. },
  34979. "connections": {
  34980. "I0": [ "0" ],
  34981. "I1": [ "0" ],
  34982. "I2": [ 1391 ],
  34983. "I3": [ 1393 ],
  34984. "O": [ 1375 ]
  34985. }
  34986. },
  34987. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  34988. "hide_name": 0,
  34989. "type": "SB_LUT4",
  34990. "parameters": {
  34991. "LUT_INIT": "0011111100110101"
  34992. },
  34993. "attributes": {
  34994. "module_not_derived": "00000000000000000000000000000001",
  34995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  34996. },
  34997. "port_directions": {
  34998. "I0": "input",
  34999. "I1": "input",
  35000. "I2": "input",
  35001. "I3": "input",
  35002. "O": "output"
  35003. },
  35004. "connections": {
  35005. "I0": [ 1208 ],
  35006. "I1": [ 1090 ],
  35007. "I2": [ 1050 ],
  35008. "I3": [ 1052 ],
  35009. "O": [ 1450 ]
  35010. }
  35011. },
  35012. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  35013. "hide_name": 0,
  35014. "type": "SB_LUT4",
  35015. "parameters": {
  35016. "LUT_INIT": "0110100110010110"
  35017. },
  35018. "attributes": {
  35019. "module_not_derived": "00000000000000000000000000000001",
  35020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1482.22-1482.41|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35021. },
  35022. "port_directions": {
  35023. "I0": "input",
  35024. "I1": "input",
  35025. "I2": "input",
  35026. "I3": "input",
  35027. "O": "output"
  35028. },
  35029. "connections": {
  35030. "I0": [ "0" ],
  35031. "I1": [ 1391 ],
  35032. "I2": [ "1" ],
  35033. "I3": [ 1023 ],
  35034. "O": [ 1393 ]
  35035. }
  35036. },
  35037. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2": {
  35038. "hide_name": 0,
  35039. "type": "SB_LUT4",
  35040. "parameters": {
  35041. "LUT_INIT": "1100000011111111"
  35042. },
  35043. "attributes": {
  35044. "module_not_derived": "00000000000000000000000000000001",
  35045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  35046. },
  35047. "port_directions": {
  35048. "I0": "input",
  35049. "I1": "input",
  35050. "I2": "input",
  35051. "I3": "input",
  35052. "O": "output"
  35053. },
  35054. "connections": {
  35055. "I0": [ "0" ],
  35056. "I1": [ 1451 ],
  35057. "I2": [ 1367 ],
  35058. "I3": [ 1452 ],
  35059. "O": [ 1453 ]
  35060. }
  35061. },
  35062. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O": {
  35063. "hide_name": 0,
  35064. "type": "SB_LUT4",
  35065. "parameters": {
  35066. "LUT_INIT": "0000000001001100"
  35067. },
  35068. "attributes": {
  35069. "module_not_derived": "00000000000000000000000000000001",
  35070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35071. },
  35072. "port_directions": {
  35073. "I0": "input",
  35074. "I1": "input",
  35075. "I2": "input",
  35076. "I3": "input",
  35077. "O": "output"
  35078. },
  35079. "connections": {
  35080. "I0": [ 1454 ],
  35081. "I1": [ 1455 ],
  35082. "I2": [ 1375 ],
  35083. "I3": [ 1456 ],
  35084. "O": [ 1452 ]
  35085. }
  35086. },
  35087. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  35088. "hide_name": 0,
  35089. "type": "SB_LUT4",
  35090. "parameters": {
  35091. "LUT_INIT": "0011111100110101"
  35092. },
  35093. "attributes": {
  35094. "module_not_derived": "00000000000000000000000000000001",
  35095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35096. },
  35097. "port_directions": {
  35098. "I0": "input",
  35099. "I1": "input",
  35100. "I2": "input",
  35101. "I3": "input",
  35102. "O": "output"
  35103. },
  35104. "connections": {
  35105. "I0": [ 1222 ],
  35106. "I1": [ 1041 ],
  35107. "I2": [ 1050 ],
  35108. "I3": [ 1052 ],
  35109. "O": [ 1455 ]
  35110. }
  35111. },
  35112. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  35113. "hide_name": 0,
  35114. "type": "SB_LUT4",
  35115. "parameters": {
  35116. "LUT_INIT": "1010110000000000"
  35117. },
  35118. "attributes": {
  35119. "module_not_derived": "00000000000000000000000000000001",
  35120. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35121. },
  35122. "port_directions": {
  35123. "I0": "input",
  35124. "I1": "input",
  35125. "I2": "input",
  35126. "I3": "input",
  35127. "O": "output"
  35128. },
  35129. "connections": {
  35130. "I0": [ 1457 ],
  35131. "I1": [ 1458 ],
  35132. "I2": [ 1378 ],
  35133. "I3": [ 1380 ],
  35134. "O": [ 1456 ]
  35135. }
  35136. },
  35137. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I1_SB_LUT4_O": {
  35138. "hide_name": 0,
  35139. "type": "SB_LUT4",
  35140. "parameters": {
  35141. "LUT_INIT": "0110100110010110"
  35142. },
  35143. "attributes": {
  35144. "module_not_derived": "00000000000000000000000000000001",
  35145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35146. },
  35147. "port_directions": {
  35148. "I0": "input",
  35149. "I1": "input",
  35150. "I2": "input",
  35151. "I3": "input",
  35152. "O": "output"
  35153. },
  35154. "connections": {
  35155. "I0": [ "0" ],
  35156. "I1": [ "0" ],
  35157. "I2": [ 1449 ],
  35158. "I3": [ 1448 ],
  35159. "O": [ 1458 ]
  35160. }
  35161. },
  35162. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O": {
  35163. "hide_name": 0,
  35164. "type": "SB_LUT4",
  35165. "parameters": {
  35166. "LUT_INIT": "0000001100001111"
  35167. },
  35168. "attributes": {
  35169. "module_not_derived": "00000000000000000000000000000001",
  35170. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  35171. },
  35172. "port_directions": {
  35173. "I0": "input",
  35174. "I1": "input",
  35175. "I2": "input",
  35176. "I3": "input",
  35177. "O": "output"
  35178. },
  35179. "connections": {
  35180. "I0": [ "0" ],
  35181. "I1": [ 1459 ],
  35182. "I2": [ 1460 ],
  35183. "I3": [ 1375 ],
  35184. "O": [ 1438 ]
  35185. }
  35186. },
  35187. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1": {
  35188. "hide_name": 0,
  35189. "type": "SB_LUT4",
  35190. "parameters": {
  35191. "LUT_INIT": "1010110000000000"
  35192. },
  35193. "attributes": {
  35194. "module_not_derived": "00000000000000000000000000000001",
  35195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35196. },
  35197. "port_directions": {
  35198. "I0": "input",
  35199. "I1": "input",
  35200. "I2": "input",
  35201. "I3": "input",
  35202. "O": "output"
  35203. },
  35204. "connections": {
  35205. "I0": [ 1461 ],
  35206. "I1": [ 1462 ],
  35207. "I2": [ 1378 ],
  35208. "I3": [ 1380 ],
  35209. "O": [ 1437 ]
  35210. }
  35211. },
  35212. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O": {
  35213. "hide_name": 0,
  35214. "type": "SB_LUT4",
  35215. "parameters": {
  35216. "LUT_INIT": "0110100110010110"
  35217. },
  35218. "attributes": {
  35219. "module_not_derived": "00000000000000000000000000000001",
  35220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35221. },
  35222. "port_directions": {
  35223. "I0": "input",
  35224. "I1": "input",
  35225. "I2": "input",
  35226. "I3": "input",
  35227. "O": "output"
  35228. },
  35229. "connections": {
  35230. "I0": [ "0" ],
  35231. "I1": [ 1463 ],
  35232. "I2": [ 1464 ],
  35233. "I3": [ "0" ],
  35234. "O": [ 1462 ]
  35235. }
  35236. },
  35237. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_CARRY_I0": {
  35238. "hide_name": 0,
  35239. "type": "SB_CARRY",
  35240. "parameters": {
  35241. },
  35242. "attributes": {
  35243. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  35244. },
  35245. "port_directions": {
  35246. "CI": "input",
  35247. "CO": "output",
  35248. "I0": "input",
  35249. "I1": "input"
  35250. },
  35251. "connections": {
  35252. "CI": [ "0" ],
  35253. "CO": [ 1448 ],
  35254. "I0": [ 1463 ],
  35255. "I1": [ 1464 ]
  35256. }
  35257. },
  35258. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_DFFR_Q": {
  35259. "hide_name": 0,
  35260. "type": "SB_DFFR",
  35261. "parameters": {
  35262. },
  35263. "attributes": {
  35264. "module_not_derived": "00000000000000000000000000000001",
  35265. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  35266. },
  35267. "port_directions": {
  35268. "C": "input",
  35269. "D": "input",
  35270. "Q": "output",
  35271. "R": "input"
  35272. },
  35273. "connections": {
  35274. "C": [ 42 ],
  35275. "D": [ 1465 ],
  35276. "Q": [ 1463 ],
  35277. "R": [ 127 ]
  35278. }
  35279. },
  35280. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0": {
  35281. "hide_name": 0,
  35282. "type": "SB_LUT4",
  35283. "parameters": {
  35284. "LUT_INIT": "1111111110000000"
  35285. },
  35286. "attributes": {
  35287. "module_not_derived": "00000000000000000000000000000001",
  35288. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35289. },
  35290. "port_directions": {
  35291. "I0": "input",
  35292. "I1": "input",
  35293. "I2": "input",
  35294. "I3": "input",
  35295. "O": "output"
  35296. },
  35297. "connections": {
  35298. "I0": [ 1463 ],
  35299. "I1": [ 1380 ],
  35300. "I2": [ 1466 ],
  35301. "I3": [ 1467 ],
  35302. "O": [ 1465 ]
  35303. }
  35304. },
  35305. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3": {
  35306. "hide_name": 0,
  35307. "type": "SB_LUT4",
  35308. "parameters": {
  35309. "LUT_INIT": "1111111110000000"
  35310. },
  35311. "attributes": {
  35312. "module_not_derived": "00000000000000000000000000000001",
  35313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35314. },
  35315. "port_directions": {
  35316. "I0": "input",
  35317. "I1": "input",
  35318. "I2": "input",
  35319. "I3": "input",
  35320. "O": "output"
  35321. },
  35322. "connections": {
  35323. "I0": [ 1468 ],
  35324. "I1": [ 1469 ],
  35325. "I2": [ 1466 ],
  35326. "I3": [ 1467 ],
  35327. "O": [ 1470 ]
  35328. }
  35329. },
  35330. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I0": {
  35331. "hide_name": 0,
  35332. "type": "SB_LUT4",
  35333. "parameters": {
  35334. "LUT_INIT": "0010000000000000"
  35335. },
  35336. "attributes": {
  35337. "module_not_derived": "00000000000000000000000000000001",
  35338. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35339. },
  35340. "port_directions": {
  35341. "I0": "input",
  35342. "I1": "input",
  35343. "I2": "input",
  35344. "I3": "input",
  35345. "O": "output"
  35346. },
  35347. "connections": {
  35348. "I0": [ 1468 ],
  35349. "I1": [ 1471 ],
  35350. "I2": [ 1469 ],
  35351. "I3": [ 1472 ],
  35352. "O": [ 1473 ]
  35353. }
  35354. },
  35355. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I0_O_SB_LUT4_I3": {
  35356. "hide_name": 0,
  35357. "type": "SB_LUT4",
  35358. "parameters": {
  35359. "LUT_INIT": "0000110011001100"
  35360. },
  35361. "attributes": {
  35362. "module_not_derived": "00000000000000000000000000000001",
  35363. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  35364. },
  35365. "port_directions": {
  35366. "I0": "input",
  35367. "I1": "input",
  35368. "I2": "input",
  35369. "I3": "input",
  35370. "O": "output"
  35371. },
  35372. "connections": {
  35373. "I0": [ "0" ],
  35374. "I1": [ 1356 ],
  35375. "I2": [ 1380 ],
  35376. "I3": [ 1466 ],
  35377. "O": [ 1474 ]
  35378. }
  35379. },
  35380. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I0_O_SB_LUT4_O": {
  35381. "hide_name": 0,
  35382. "type": "SB_LUT4",
  35383. "parameters": {
  35384. "LUT_INIT": "0000000000001111"
  35385. },
  35386. "attributes": {
  35387. "module_not_derived": "00000000000000000000000000000001",
  35388. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  35389. },
  35390. "port_directions": {
  35391. "I0": "input",
  35392. "I1": "input",
  35393. "I2": "input",
  35394. "I3": "input",
  35395. "O": "output"
  35396. },
  35397. "connections": {
  35398. "I0": [ "0" ],
  35399. "I1": [ "0" ],
  35400. "I2": [ 1378 ],
  35401. "I3": [ 1475 ],
  35402. "O": [ 1466 ]
  35403. }
  35404. },
  35405. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I2": {
  35406. "hide_name": 0,
  35407. "type": "SB_LUT4",
  35408. "parameters": {
  35409. "LUT_INIT": "0000000000001100"
  35410. },
  35411. "attributes": {
  35412. "module_not_derived": "00000000000000000000000000000001",
  35413. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  35414. },
  35415. "port_directions": {
  35416. "I0": "input",
  35417. "I1": "input",
  35418. "I2": "input",
  35419. "I3": "input",
  35420. "O": "output"
  35421. },
  35422. "connections": {
  35423. "I0": [ "0" ],
  35424. "I1": [ 1358 ],
  35425. "I2": [ 1468 ],
  35426. "I3": [ 842 ],
  35427. "O": [ 1359 ]
  35428. }
  35429. },
  35430. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I2_O_SB_LUT4_I3": {
  35431. "hide_name": 0,
  35432. "type": "SB_LUT4",
  35433. "parameters": {
  35434. "LUT_INIT": "1111111100001111"
  35435. },
  35436. "attributes": {
  35437. "module_not_derived": "00000000000000000000000000000001",
  35438. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  35439. },
  35440. "port_directions": {
  35441. "I0": "input",
  35442. "I1": "input",
  35443. "I2": "input",
  35444. "I3": "input",
  35445. "O": "output"
  35446. },
  35447. "connections": {
  35448. "I0": [ "0" ],
  35449. "I1": [ "0" ],
  35450. "I2": [ 1353 ],
  35451. "I3": [ 1359 ],
  35452. "O": [ 1476 ]
  35453. }
  35454. },
  35455. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_DFFR_D": {
  35456. "hide_name": 0,
  35457. "type": "SB_DFFR",
  35458. "parameters": {
  35459. },
  35460. "attributes": {
  35461. "module_not_derived": "00000000000000000000000000000001",
  35462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  35463. },
  35464. "port_directions": {
  35465. "C": "input",
  35466. "D": "input",
  35467. "Q": "output",
  35468. "R": "input"
  35469. },
  35470. "connections": {
  35471. "C": [ 42 ],
  35472. "D": [ 1470 ],
  35473. "Q": [ 1468 ],
  35474. "R": [ 127 ]
  35475. }
  35476. },
  35477. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_O": {
  35478. "hide_name": 0,
  35479. "type": "SB_LUT4",
  35480. "parameters": {
  35481. "LUT_INIT": "1111000000000000"
  35482. },
  35483. "attributes": {
  35484. "module_not_derived": "00000000000000000000000000000001",
  35485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  35486. },
  35487. "port_directions": {
  35488. "I0": "input",
  35489. "I1": "input",
  35490. "I2": "input",
  35491. "I3": "input",
  35492. "O": "output"
  35493. },
  35494. "connections": {
  35495. "I0": [ "0" ],
  35496. "I1": [ "0" ],
  35497. "I2": [ 1477 ],
  35498. "I3": [ 1472 ],
  35499. "O": [ 1467 ]
  35500. }
  35501. },
  35502. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  35503. "hide_name": 0,
  35504. "type": "SB_LUT4",
  35505. "parameters": {
  35506. "LUT_INIT": "0000000000000100"
  35507. },
  35508. "attributes": {
  35509. "module_not_derived": "00000000000000000000000000000001",
  35510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35511. },
  35512. "port_directions": {
  35513. "I0": "input",
  35514. "I1": "input",
  35515. "I2": "input",
  35516. "I3": "input",
  35517. "O": "output"
  35518. },
  35519. "connections": {
  35520. "I0": [ 1360 ],
  35521. "I1": [ 1361 ],
  35522. "I2": [ 1023 ],
  35523. "I3": [ 1478 ],
  35524. "O": [ 1477 ]
  35525. }
  35526. },
  35527. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  35528. "hide_name": 0,
  35529. "type": "SB_LUT4",
  35530. "parameters": {
  35531. "LUT_INIT": "1100000011001010"
  35532. },
  35533. "attributes": {
  35534. "module_not_derived": "00000000000000000000000000000001",
  35535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  35536. },
  35537. "port_directions": {
  35538. "I0": "input",
  35539. "I1": "input",
  35540. "I2": "input",
  35541. "I3": "input",
  35542. "O": "output"
  35543. },
  35544. "connections": {
  35545. "I0": [ 1224 ],
  35546. "I1": [ 1107 ],
  35547. "I2": [ 1050 ],
  35548. "I3": [ 1052 ],
  35549. "O": [ 1460 ]
  35550. }
  35551. },
  35552. "cpu_I.IBusCachedPlugin_cache.decodeStage_hit_valid_SB_DFFE_Q": {
  35553. "hide_name": 0,
  35554. "type": "SB_DFFE",
  35555. "parameters": {
  35556. },
  35557. "attributes": {
  35558. "module_not_derived": "00000000000000000000000000000001",
  35559. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35560. },
  35561. "port_directions": {
  35562. "C": "input",
  35563. "D": "input",
  35564. "E": "input",
  35565. "Q": "output"
  35566. },
  35567. "connections": {
  35568. "C": [ 42 ],
  35569. "D": [ 1479 ],
  35570. "E": [ 1472 ],
  35571. "Q": [ 1480 ]
  35572. }
  35573. },
  35574. "cpu_I.IBusCachedPlugin_cache.decodeStage_hit_valid_SB_LUT4_I2": {
  35575. "hide_name": 0,
  35576. "type": "SB_LUT4",
  35577. "parameters": {
  35578. "LUT_INIT": "1111000000000000"
  35579. },
  35580. "attributes": {
  35581. "module_not_derived": "00000000000000000000000000000001",
  35582. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  35583. },
  35584. "port_directions": {
  35585. "I0": "input",
  35586. "I1": "input",
  35587. "I2": "input",
  35588. "I3": "input",
  35589. "O": "output"
  35590. },
  35591. "connections": {
  35592. "I0": [ "0" ],
  35593. "I1": [ "0" ],
  35594. "I2": [ 1480 ],
  35595. "I3": [ 1481 ],
  35596. "O": [ 1365 ]
  35597. }
  35598. },
  35599. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q": {
  35600. "hide_name": 0,
  35601. "type": "SB_DFFE",
  35602. "parameters": {
  35603. },
  35604. "attributes": {
  35605. "module_not_derived": "00000000000000000000000000000001",
  35606. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35607. },
  35608. "port_directions": {
  35609. "C": "input",
  35610. "D": "input",
  35611. "E": "input",
  35612. "Q": "output"
  35613. },
  35614. "connections": {
  35615. "C": [ 42 ],
  35616. "D": [ 1482 ],
  35617. "E": [ 1472 ],
  35618. "Q": [ 1483 ]
  35619. }
  35620. },
  35621. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_1": {
  35622. "hide_name": 0,
  35623. "type": "SB_DFFE",
  35624. "parameters": {
  35625. },
  35626. "attributes": {
  35627. "module_not_derived": "00000000000000000000000000000001",
  35628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35629. },
  35630. "port_directions": {
  35631. "C": "input",
  35632. "D": "input",
  35633. "E": "input",
  35634. "Q": "output"
  35635. },
  35636. "connections": {
  35637. "C": [ 42 ],
  35638. "D": [ 1484 ],
  35639. "E": [ 1472 ],
  35640. "Q": [ 1485 ]
  35641. }
  35642. },
  35643. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_10": {
  35644. "hide_name": 0,
  35645. "type": "SB_DFFE",
  35646. "parameters": {
  35647. },
  35648. "attributes": {
  35649. "module_not_derived": "00000000000000000000000000000001",
  35650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35651. },
  35652. "port_directions": {
  35653. "C": "input",
  35654. "D": "input",
  35655. "E": "input",
  35656. "Q": "output"
  35657. },
  35658. "connections": {
  35659. "C": [ 42 ],
  35660. "D": [ 1486 ],
  35661. "E": [ 1472 ],
  35662. "Q": [ 1487 ]
  35663. }
  35664. },
  35665. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_11": {
  35666. "hide_name": 0,
  35667. "type": "SB_DFFE",
  35668. "parameters": {
  35669. },
  35670. "attributes": {
  35671. "module_not_derived": "00000000000000000000000000000001",
  35672. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35673. },
  35674. "port_directions": {
  35675. "C": "input",
  35676. "D": "input",
  35677. "E": "input",
  35678. "Q": "output"
  35679. },
  35680. "connections": {
  35681. "C": [ 42 ],
  35682. "D": [ 1488 ],
  35683. "E": [ 1472 ],
  35684. "Q": [ 1489 ]
  35685. }
  35686. },
  35687. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_12": {
  35688. "hide_name": 0,
  35689. "type": "SB_DFFE",
  35690. "parameters": {
  35691. },
  35692. "attributes": {
  35693. "module_not_derived": "00000000000000000000000000000001",
  35694. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35695. },
  35696. "port_directions": {
  35697. "C": "input",
  35698. "D": "input",
  35699. "E": "input",
  35700. "Q": "output"
  35701. },
  35702. "connections": {
  35703. "C": [ 42 ],
  35704. "D": [ 1490 ],
  35705. "E": [ 1472 ],
  35706. "Q": [ 1491 ]
  35707. }
  35708. },
  35709. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_13": {
  35710. "hide_name": 0,
  35711. "type": "SB_DFFE",
  35712. "parameters": {
  35713. },
  35714. "attributes": {
  35715. "module_not_derived": "00000000000000000000000000000001",
  35716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35717. },
  35718. "port_directions": {
  35719. "C": "input",
  35720. "D": "input",
  35721. "E": "input",
  35722. "Q": "output"
  35723. },
  35724. "connections": {
  35725. "C": [ 42 ],
  35726. "D": [ 1492 ],
  35727. "E": [ 1472 ],
  35728. "Q": [ 1493 ]
  35729. }
  35730. },
  35731. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_14": {
  35732. "hide_name": 0,
  35733. "type": "SB_DFFE",
  35734. "parameters": {
  35735. },
  35736. "attributes": {
  35737. "module_not_derived": "00000000000000000000000000000001",
  35738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35739. },
  35740. "port_directions": {
  35741. "C": "input",
  35742. "D": "input",
  35743. "E": "input",
  35744. "Q": "output"
  35745. },
  35746. "connections": {
  35747. "C": [ 42 ],
  35748. "D": [ 1494 ],
  35749. "E": [ 1472 ],
  35750. "Q": [ 1495 ]
  35751. }
  35752. },
  35753. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_15": {
  35754. "hide_name": 0,
  35755. "type": "SB_DFFE",
  35756. "parameters": {
  35757. },
  35758. "attributes": {
  35759. "module_not_derived": "00000000000000000000000000000001",
  35760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35761. },
  35762. "port_directions": {
  35763. "C": "input",
  35764. "D": "input",
  35765. "E": "input",
  35766. "Q": "output"
  35767. },
  35768. "connections": {
  35769. "C": [ 42 ],
  35770. "D": [ 1496 ],
  35771. "E": [ 1472 ],
  35772. "Q": [ 1497 ]
  35773. }
  35774. },
  35775. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_16": {
  35776. "hide_name": 0,
  35777. "type": "SB_DFFE",
  35778. "parameters": {
  35779. },
  35780. "attributes": {
  35781. "module_not_derived": "00000000000000000000000000000001",
  35782. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35783. },
  35784. "port_directions": {
  35785. "C": "input",
  35786. "D": "input",
  35787. "E": "input",
  35788. "Q": "output"
  35789. },
  35790. "connections": {
  35791. "C": [ 42 ],
  35792. "D": [ 1498 ],
  35793. "E": [ 1472 ],
  35794. "Q": [ 1499 ]
  35795. }
  35796. },
  35797. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_17": {
  35798. "hide_name": 0,
  35799. "type": "SB_DFFE",
  35800. "parameters": {
  35801. },
  35802. "attributes": {
  35803. "module_not_derived": "00000000000000000000000000000001",
  35804. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35805. },
  35806. "port_directions": {
  35807. "C": "input",
  35808. "D": "input",
  35809. "E": "input",
  35810. "Q": "output"
  35811. },
  35812. "connections": {
  35813. "C": [ 42 ],
  35814. "D": [ 1500 ],
  35815. "E": [ 1472 ],
  35816. "Q": [ 1501 ]
  35817. }
  35818. },
  35819. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_18": {
  35820. "hide_name": 0,
  35821. "type": "SB_DFFE",
  35822. "parameters": {
  35823. },
  35824. "attributes": {
  35825. "module_not_derived": "00000000000000000000000000000001",
  35826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35827. },
  35828. "port_directions": {
  35829. "C": "input",
  35830. "D": "input",
  35831. "E": "input",
  35832. "Q": "output"
  35833. },
  35834. "connections": {
  35835. "C": [ 42 ],
  35836. "D": [ 1502 ],
  35837. "E": [ 1472 ],
  35838. "Q": [ 1503 ]
  35839. }
  35840. },
  35841. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_19": {
  35842. "hide_name": 0,
  35843. "type": "SB_DFFE",
  35844. "parameters": {
  35845. },
  35846. "attributes": {
  35847. "module_not_derived": "00000000000000000000000000000001",
  35848. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35849. },
  35850. "port_directions": {
  35851. "C": "input",
  35852. "D": "input",
  35853. "E": "input",
  35854. "Q": "output"
  35855. },
  35856. "connections": {
  35857. "C": [ 42 ],
  35858. "D": [ 1504 ],
  35859. "E": [ 1472 ],
  35860. "Q": [ 1505 ]
  35861. }
  35862. },
  35863. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_2": {
  35864. "hide_name": 0,
  35865. "type": "SB_DFFE",
  35866. "parameters": {
  35867. },
  35868. "attributes": {
  35869. "module_not_derived": "00000000000000000000000000000001",
  35870. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35871. },
  35872. "port_directions": {
  35873. "C": "input",
  35874. "D": "input",
  35875. "E": "input",
  35876. "Q": "output"
  35877. },
  35878. "connections": {
  35879. "C": [ 42 ],
  35880. "D": [ 1506 ],
  35881. "E": [ 1472 ],
  35882. "Q": [ 1507 ]
  35883. }
  35884. },
  35885. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_20": {
  35886. "hide_name": 0,
  35887. "type": "SB_DFFE",
  35888. "parameters": {
  35889. },
  35890. "attributes": {
  35891. "module_not_derived": "00000000000000000000000000000001",
  35892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35893. },
  35894. "port_directions": {
  35895. "C": "input",
  35896. "D": "input",
  35897. "E": "input",
  35898. "Q": "output"
  35899. },
  35900. "connections": {
  35901. "C": [ 42 ],
  35902. "D": [ 1508 ],
  35903. "E": [ 1472 ],
  35904. "Q": [ 1509 ]
  35905. }
  35906. },
  35907. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_21": {
  35908. "hide_name": 0,
  35909. "type": "SB_DFFE",
  35910. "parameters": {
  35911. },
  35912. "attributes": {
  35913. "module_not_derived": "00000000000000000000000000000001",
  35914. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35915. },
  35916. "port_directions": {
  35917. "C": "input",
  35918. "D": "input",
  35919. "E": "input",
  35920. "Q": "output"
  35921. },
  35922. "connections": {
  35923. "C": [ 42 ],
  35924. "D": [ 1434 ],
  35925. "E": [ 1472 ],
  35926. "Q": [ 1432 ]
  35927. }
  35928. },
  35929. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_22": {
  35930. "hide_name": 0,
  35931. "type": "SB_DFFE",
  35932. "parameters": {
  35933. },
  35934. "attributes": {
  35935. "module_not_derived": "00000000000000000000000000000001",
  35936. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35937. },
  35938. "port_directions": {
  35939. "C": "input",
  35940. "D": "input",
  35941. "E": "input",
  35942. "Q": "output"
  35943. },
  35944. "connections": {
  35945. "C": [ 42 ],
  35946. "D": [ 1381 ],
  35947. "E": [ 1472 ],
  35948. "Q": [ 1377 ]
  35949. }
  35950. },
  35951. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_23": {
  35952. "hide_name": 0,
  35953. "type": "SB_DFFE",
  35954. "parameters": {
  35955. },
  35956. "attributes": {
  35957. "module_not_derived": "00000000000000000000000000000001",
  35958. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35959. },
  35960. "port_directions": {
  35961. "C": "input",
  35962. "D": "input",
  35963. "E": "input",
  35964. "Q": "output"
  35965. },
  35966. "connections": {
  35967. "C": [ 42 ],
  35968. "D": [ 1384 ],
  35969. "E": [ 1472 ],
  35970. "Q": [ 1394 ]
  35971. }
  35972. },
  35973. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_24": {
  35974. "hide_name": 0,
  35975. "type": "SB_DFFE",
  35976. "parameters": {
  35977. },
  35978. "attributes": {
  35979. "module_not_derived": "00000000000000000000000000000001",
  35980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  35981. },
  35982. "port_directions": {
  35983. "C": "input",
  35984. "D": "input",
  35985. "E": "input",
  35986. "Q": "output"
  35987. },
  35988. "connections": {
  35989. "C": [ 42 ],
  35990. "D": [ 1397 ],
  35991. "E": [ 1472 ],
  35992. "Q": [ 1404 ]
  35993. }
  35994. },
  35995. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_25": {
  35996. "hide_name": 0,
  35997. "type": "SB_DFFE",
  35998. "parameters": {
  35999. },
  36000. "attributes": {
  36001. "module_not_derived": "00000000000000000000000000000001",
  36002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36003. },
  36004. "port_directions": {
  36005. "C": "input",
  36006. "D": "input",
  36007. "E": "input",
  36008. "Q": "output"
  36009. },
  36010. "connections": {
  36011. "C": [ 42 ],
  36012. "D": [ 1407 ],
  36013. "E": [ 1472 ],
  36014. "Q": [ 1414 ]
  36015. }
  36016. },
  36017. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_26": {
  36018. "hide_name": 0,
  36019. "type": "SB_DFFE",
  36020. "parameters": {
  36021. },
  36022. "attributes": {
  36023. "module_not_derived": "00000000000000000000000000000001",
  36024. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36025. },
  36026. "port_directions": {
  36027. "C": "input",
  36028. "D": "input",
  36029. "E": "input",
  36030. "Q": "output"
  36031. },
  36032. "connections": {
  36033. "C": [ 42 ],
  36034. "D": [ 1424 ],
  36035. "E": [ 1472 ],
  36036. "Q": [ 1422 ]
  36037. }
  36038. },
  36039. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_27": {
  36040. "hide_name": 0,
  36041. "type": "SB_DFFE",
  36042. "parameters": {
  36043. },
  36044. "attributes": {
  36045. "module_not_derived": "00000000000000000000000000000001",
  36046. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36047. },
  36048. "port_directions": {
  36049. "C": "input",
  36050. "D": "input",
  36051. "E": "input",
  36052. "Q": "output"
  36053. },
  36054. "connections": {
  36055. "C": [ 42 ],
  36056. "D": [ 1427 ],
  36057. "E": [ 1472 ],
  36058. "Q": [ 1446 ]
  36059. }
  36060. },
  36061. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_28": {
  36062. "hide_name": 0,
  36063. "type": "SB_DFFE",
  36064. "parameters": {
  36065. },
  36066. "attributes": {
  36067. "module_not_derived": "00000000000000000000000000000001",
  36068. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36069. },
  36070. "port_directions": {
  36071. "C": "input",
  36072. "D": "input",
  36073. "E": "input",
  36074. "Q": "output"
  36075. },
  36076. "connections": {
  36077. "C": [ 42 ],
  36078. "D": [ 1449 ],
  36079. "E": [ 1472 ],
  36080. "Q": [ 1457 ]
  36081. }
  36082. },
  36083. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_29": {
  36084. "hide_name": 0,
  36085. "type": "SB_DFFE",
  36086. "parameters": {
  36087. },
  36088. "attributes": {
  36089. "module_not_derived": "00000000000000000000000000000001",
  36090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36091. },
  36092. "port_directions": {
  36093. "C": "input",
  36094. "D": "input",
  36095. "E": "input",
  36096. "Q": "output"
  36097. },
  36098. "connections": {
  36099. "C": [ 42 ],
  36100. "D": [ 1464 ],
  36101. "E": [ 1472 ],
  36102. "Q": [ 1461 ]
  36103. }
  36104. },
  36105. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_3": {
  36106. "hide_name": 0,
  36107. "type": "SB_DFFE",
  36108. "parameters": {
  36109. },
  36110. "attributes": {
  36111. "module_not_derived": "00000000000000000000000000000001",
  36112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36113. },
  36114. "port_directions": {
  36115. "C": "input",
  36116. "D": "input",
  36117. "E": "input",
  36118. "Q": "output"
  36119. },
  36120. "connections": {
  36121. "C": [ 42 ],
  36122. "D": [ 1510 ],
  36123. "E": [ 1472 ],
  36124. "Q": [ 1511 ]
  36125. }
  36126. },
  36127. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_4": {
  36128. "hide_name": 0,
  36129. "type": "SB_DFFE",
  36130. "parameters": {
  36131. },
  36132. "attributes": {
  36133. "module_not_derived": "00000000000000000000000000000001",
  36134. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36135. },
  36136. "port_directions": {
  36137. "C": "input",
  36138. "D": "input",
  36139. "E": "input",
  36140. "Q": "output"
  36141. },
  36142. "connections": {
  36143. "C": [ 42 ],
  36144. "D": [ 1512 ],
  36145. "E": [ 1472 ],
  36146. "Q": [ 1513 ]
  36147. }
  36148. },
  36149. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_5": {
  36150. "hide_name": 0,
  36151. "type": "SB_DFFE",
  36152. "parameters": {
  36153. },
  36154. "attributes": {
  36155. "module_not_derived": "00000000000000000000000000000001",
  36156. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36157. },
  36158. "port_directions": {
  36159. "C": "input",
  36160. "D": "input",
  36161. "E": "input",
  36162. "Q": "output"
  36163. },
  36164. "connections": {
  36165. "C": [ 42 ],
  36166. "D": [ 1514 ],
  36167. "E": [ 1472 ],
  36168. "Q": [ 1515 ]
  36169. }
  36170. },
  36171. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_6": {
  36172. "hide_name": 0,
  36173. "type": "SB_DFFE",
  36174. "parameters": {
  36175. },
  36176. "attributes": {
  36177. "module_not_derived": "00000000000000000000000000000001",
  36178. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36179. },
  36180. "port_directions": {
  36181. "C": "input",
  36182. "D": "input",
  36183. "E": "input",
  36184. "Q": "output"
  36185. },
  36186. "connections": {
  36187. "C": [ 42 ],
  36188. "D": [ 1516 ],
  36189. "E": [ 1472 ],
  36190. "Q": [ 1517 ]
  36191. }
  36192. },
  36193. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_7": {
  36194. "hide_name": 0,
  36195. "type": "SB_DFFE",
  36196. "parameters": {
  36197. },
  36198. "attributes": {
  36199. "module_not_derived": "00000000000000000000000000000001",
  36200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36201. },
  36202. "port_directions": {
  36203. "C": "input",
  36204. "D": "input",
  36205. "E": "input",
  36206. "Q": "output"
  36207. },
  36208. "connections": {
  36209. "C": [ 42 ],
  36210. "D": [ 1518 ],
  36211. "E": [ 1472 ],
  36212. "Q": [ 1519 ]
  36213. }
  36214. },
  36215. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_8": {
  36216. "hide_name": 0,
  36217. "type": "SB_DFFE",
  36218. "parameters": {
  36219. },
  36220. "attributes": {
  36221. "module_not_derived": "00000000000000000000000000000001",
  36222. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36223. },
  36224. "port_directions": {
  36225. "C": "input",
  36226. "D": "input",
  36227. "E": "input",
  36228. "Q": "output"
  36229. },
  36230. "connections": {
  36231. "C": [ 42 ],
  36232. "D": [ 1520 ],
  36233. "E": [ 1472 ],
  36234. "Q": [ 1521 ]
  36235. }
  36236. },
  36237. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress_SB_DFFE_Q_9": {
  36238. "hide_name": 0,
  36239. "type": "SB_DFFE",
  36240. "parameters": {
  36241. },
  36242. "attributes": {
  36243. "module_not_derived": "00000000000000000000000000000001",
  36244. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36245. },
  36246. "port_directions": {
  36247. "C": "input",
  36248. "D": "input",
  36249. "E": "input",
  36250. "Q": "output"
  36251. },
  36252. "connections": {
  36253. "C": [ 42 ],
  36254. "D": [ 1522 ],
  36255. "E": [ 1472 ],
  36256. "Q": [ 1523 ]
  36257. }
  36258. },
  36259. "cpu_I.IBusCachedPlugin_cache.fetchStage_hit_hits_0_SB_LUT4_O": {
  36260. "hide_name": 0,
  36261. "type": "SB_LUT4",
  36262. "parameters": {
  36263. "LUT_INIT": "0100000000000000"
  36264. },
  36265. "attributes": {
  36266. "module_not_derived": "00000000000000000000000000000001",
  36267. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  36268. },
  36269. "port_directions": {
  36270. "I0": "input",
  36271. "I1": "input",
  36272. "I2": "input",
  36273. "I3": "input",
  36274. "O": "output"
  36275. },
  36276. "connections": {
  36277. "I0": [ 1524 ],
  36278. "I1": [ 1525 ],
  36279. "I2": [ 1526 ],
  36280. "I3": [ 1527 ],
  36281. "O": [ 1479 ]
  36282. }
  36283. },
  36284. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q": {
  36285. "hide_name": 0,
  36286. "type": "SB_DFFE",
  36287. "parameters": {
  36288. },
  36289. "attributes": {
  36290. "module_not_derived": "00000000000000000000000000000001",
  36291. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36292. },
  36293. "port_directions": {
  36294. "C": "input",
  36295. "D": "input",
  36296. "E": "input",
  36297. "Q": "output"
  36298. },
  36299. "connections": {
  36300. "C": [ 42 ],
  36301. "D": [ 1292 ],
  36302. "E": [ 1472 ],
  36303. "Q": [ 1528 ]
  36304. }
  36305. },
  36306. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_1": {
  36307. "hide_name": 0,
  36308. "type": "SB_DFFE",
  36309. "parameters": {
  36310. },
  36311. "attributes": {
  36312. "module_not_derived": "00000000000000000000000000000001",
  36313. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36314. },
  36315. "port_directions": {
  36316. "C": "input",
  36317. "D": "input",
  36318. "E": "input",
  36319. "Q": "output"
  36320. },
  36321. "connections": {
  36322. "C": [ 42 ],
  36323. "D": [ 1289 ],
  36324. "E": [ 1472 ],
  36325. "Q": [ 1529 ]
  36326. }
  36327. },
  36328. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_10": {
  36329. "hide_name": 0,
  36330. "type": "SB_DFFE",
  36331. "parameters": {
  36332. },
  36333. "attributes": {
  36334. "module_not_derived": "00000000000000000000000000000001",
  36335. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36336. },
  36337. "port_directions": {
  36338. "C": "input",
  36339. "D": "input",
  36340. "E": "input",
  36341. "Q": "output"
  36342. },
  36343. "connections": {
  36344. "C": [ 42 ],
  36345. "D": [ 1313 ],
  36346. "E": [ 1472 ],
  36347. "Q": [ 1530 ]
  36348. }
  36349. },
  36350. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_11": {
  36351. "hide_name": 0,
  36352. "type": "SB_DFFE",
  36353. "parameters": {
  36354. },
  36355. "attributes": {
  36356. "module_not_derived": "00000000000000000000000000000001",
  36357. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36358. },
  36359. "port_directions": {
  36360. "C": "input",
  36361. "D": "input",
  36362. "E": "input",
  36363. "Q": "output"
  36364. },
  36365. "connections": {
  36366. "C": [ 42 ],
  36367. "D": [ 1316 ],
  36368. "E": [ 1472 ],
  36369. "Q": [ 1531 ]
  36370. }
  36371. },
  36372. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_12": {
  36373. "hide_name": 0,
  36374. "type": "SB_DFFE",
  36375. "parameters": {
  36376. },
  36377. "attributes": {
  36378. "module_not_derived": "00000000000000000000000000000001",
  36379. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36380. },
  36381. "port_directions": {
  36382. "C": "input",
  36383. "D": "input",
  36384. "E": "input",
  36385. "Q": "output"
  36386. },
  36387. "connections": {
  36388. "C": [ 42 ],
  36389. "D": [ 1319 ],
  36390. "E": [ 1472 ],
  36391. "Q": [ 1532 ]
  36392. }
  36393. },
  36394. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_13": {
  36395. "hide_name": 0,
  36396. "type": "SB_DFFE",
  36397. "parameters": {
  36398. },
  36399. "attributes": {
  36400. "module_not_derived": "00000000000000000000000000000001",
  36401. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36402. },
  36403. "port_directions": {
  36404. "C": "input",
  36405. "D": "input",
  36406. "E": "input",
  36407. "Q": "output"
  36408. },
  36409. "connections": {
  36410. "C": [ 42 ],
  36411. "D": [ 1322 ],
  36412. "E": [ 1472 ],
  36413. "Q": [ 1533 ]
  36414. }
  36415. },
  36416. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_14": {
  36417. "hide_name": 0,
  36418. "type": "SB_DFFE",
  36419. "parameters": {
  36420. },
  36421. "attributes": {
  36422. "module_not_derived": "00000000000000000000000000000001",
  36423. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36424. },
  36425. "port_directions": {
  36426. "C": "input",
  36427. "D": "input",
  36428. "E": "input",
  36429. "Q": "output"
  36430. },
  36431. "connections": {
  36432. "C": [ 42 ],
  36433. "D": [ 1325 ],
  36434. "E": [ 1472 ],
  36435. "Q": [ 1534 ]
  36436. }
  36437. },
  36438. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_15": {
  36439. "hide_name": 0,
  36440. "type": "SB_DFFE",
  36441. "parameters": {
  36442. },
  36443. "attributes": {
  36444. "module_not_derived": "00000000000000000000000000000001",
  36445. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36446. },
  36447. "port_directions": {
  36448. "C": "input",
  36449. "D": "input",
  36450. "E": "input",
  36451. "Q": "output"
  36452. },
  36453. "connections": {
  36454. "C": [ 42 ],
  36455. "D": [ 1331 ],
  36456. "E": [ 1472 ],
  36457. "Q": [ 1535 ]
  36458. }
  36459. },
  36460. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_16": {
  36461. "hide_name": 0,
  36462. "type": "SB_DFFE",
  36463. "parameters": {
  36464. },
  36465. "attributes": {
  36466. "module_not_derived": "00000000000000000000000000000001",
  36467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36468. },
  36469. "port_directions": {
  36470. "C": "input",
  36471. "D": "input",
  36472. "E": "input",
  36473. "Q": "output"
  36474. },
  36475. "connections": {
  36476. "C": [ 42 ],
  36477. "D": [ 1274 ],
  36478. "E": [ 1472 ],
  36479. "Q": [ 1536 ]
  36480. }
  36481. },
  36482. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_17": {
  36483. "hide_name": 0,
  36484. "type": "SB_DFFE",
  36485. "parameters": {
  36486. },
  36487. "attributes": {
  36488. "module_not_derived": "00000000000000000000000000000001",
  36489. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36490. },
  36491. "port_directions": {
  36492. "C": "input",
  36493. "D": "input",
  36494. "E": "input",
  36495. "Q": "output"
  36496. },
  36497. "connections": {
  36498. "C": [ 42 ],
  36499. "D": [ 1271 ],
  36500. "E": [ 1472 ],
  36501. "Q": [ 1537 ]
  36502. }
  36503. },
  36504. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_18": {
  36505. "hide_name": 0,
  36506. "type": "SB_DFFE",
  36507. "parameters": {
  36508. },
  36509. "attributes": {
  36510. "module_not_derived": "00000000000000000000000000000001",
  36511. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36512. },
  36513. "port_directions": {
  36514. "C": "input",
  36515. "D": "input",
  36516. "E": "input",
  36517. "Q": "output"
  36518. },
  36519. "connections": {
  36520. "C": [ 42 ],
  36521. "D": [ 1265 ],
  36522. "E": [ 1472 ],
  36523. "Q": [ 1538 ]
  36524. }
  36525. },
  36526. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_19": {
  36527. "hide_name": 0,
  36528. "type": "SB_DFFE",
  36529. "parameters": {
  36530. },
  36531. "attributes": {
  36532. "module_not_derived": "00000000000000000000000000000001",
  36533. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36534. },
  36535. "port_directions": {
  36536. "C": "input",
  36537. "D": "input",
  36538. "E": "input",
  36539. "Q": "output"
  36540. },
  36541. "connections": {
  36542. "C": [ 42 ],
  36543. "D": [ 1352 ],
  36544. "E": [ 1472 ],
  36545. "Q": [ 1539 ]
  36546. }
  36547. },
  36548. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_2": {
  36549. "hide_name": 0,
  36550. "type": "SB_DFFE",
  36551. "parameters": {
  36552. },
  36553. "attributes": {
  36554. "module_not_derived": "00000000000000000000000000000001",
  36555. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36556. },
  36557. "port_directions": {
  36558. "C": "input",
  36559. "D": "input",
  36560. "E": "input",
  36561. "Q": "output"
  36562. },
  36563. "connections": {
  36564. "C": [ 42 ],
  36565. "D": [ 1286 ],
  36566. "E": [ 1472 ],
  36567. "Q": [ 1540 ]
  36568. }
  36569. },
  36570. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_20": {
  36571. "hide_name": 0,
  36572. "type": "SB_DFFE",
  36573. "parameters": {
  36574. },
  36575. "attributes": {
  36576. "module_not_derived": "00000000000000000000000000000001",
  36577. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36578. },
  36579. "port_directions": {
  36580. "C": "input",
  36581. "D": "input",
  36582. "E": "input",
  36583. "Q": "output"
  36584. },
  36585. "connections": {
  36586. "C": [ 42 ],
  36587. "D": [ 1349 ],
  36588. "E": [ 1472 ],
  36589. "Q": [ 1541 ]
  36590. }
  36591. },
  36592. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_21": {
  36593. "hide_name": 0,
  36594. "type": "SB_DFFE",
  36595. "parameters": {
  36596. },
  36597. "attributes": {
  36598. "module_not_derived": "00000000000000000000000000000001",
  36599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36600. },
  36601. "port_directions": {
  36602. "C": "input",
  36603. "D": "input",
  36604. "E": "input",
  36605. "Q": "output"
  36606. },
  36607. "connections": {
  36608. "C": [ 42 ],
  36609. "D": [ 1346 ],
  36610. "E": [ 1472 ],
  36611. "Q": [ 1542 ]
  36612. }
  36613. },
  36614. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_22": {
  36615. "hide_name": 0,
  36616. "type": "SB_DFFE",
  36617. "parameters": {
  36618. },
  36619. "attributes": {
  36620. "module_not_derived": "00000000000000000000000000000001",
  36621. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36622. },
  36623. "port_directions": {
  36624. "C": "input",
  36625. "D": "input",
  36626. "E": "input",
  36627. "Q": "output"
  36628. },
  36629. "connections": {
  36630. "C": [ 42 ],
  36631. "D": [ 1340 ],
  36632. "E": [ 1472 ],
  36633. "Q": [ 1363 ]
  36634. }
  36635. },
  36636. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_23": {
  36637. "hide_name": 0,
  36638. "type": "SB_DFFE",
  36639. "parameters": {
  36640. },
  36641. "attributes": {
  36642. "module_not_derived": "00000000000000000000000000000001",
  36643. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36644. },
  36645. "port_directions": {
  36646. "C": "input",
  36647. "D": "input",
  36648. "E": "input",
  36649. "Q": "output"
  36650. },
  36651. "connections": {
  36652. "C": [ 42 ],
  36653. "D": [ 1328 ],
  36654. "E": [ 1472 ],
  36655. "Q": [ 1543 ]
  36656. }
  36657. },
  36658. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_24": {
  36659. "hide_name": 0,
  36660. "type": "SB_DFFE",
  36661. "parameters": {
  36662. },
  36663. "attributes": {
  36664. "module_not_derived": "00000000000000000000000000000001",
  36665. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36666. },
  36667. "port_directions": {
  36668. "C": "input",
  36669. "D": "input",
  36670. "E": "input",
  36671. "Q": "output"
  36672. },
  36673. "connections": {
  36674. "C": [ 42 ],
  36675. "D": [ 1295 ],
  36676. "E": [ 1472 ],
  36677. "Q": [ 1364 ]
  36678. }
  36679. },
  36680. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_25": {
  36681. "hide_name": 0,
  36682. "type": "SB_DFFE",
  36683. "parameters": {
  36684. },
  36685. "attributes": {
  36686. "module_not_derived": "00000000000000000000000000000001",
  36687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36688. },
  36689. "port_directions": {
  36690. "C": "input",
  36691. "D": "input",
  36692. "E": "input",
  36693. "Q": "output"
  36694. },
  36695. "connections": {
  36696. "C": [ 42 ],
  36697. "D": [ 1259 ],
  36698. "E": [ 1472 ],
  36699. "Q": [ 1544 ]
  36700. }
  36701. },
  36702. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_26": {
  36703. "hide_name": 0,
  36704. "type": "SB_DFFE",
  36705. "parameters": {
  36706. },
  36707. "attributes": {
  36708. "module_not_derived": "00000000000000000000000000000001",
  36709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36710. },
  36711. "port_directions": {
  36712. "C": "input",
  36713. "D": "input",
  36714. "E": "input",
  36715. "Q": "output"
  36716. },
  36717. "connections": {
  36718. "C": [ 42 ],
  36719. "D": [ 1334 ],
  36720. "E": [ 1472 ],
  36721. "Q": [ 1545 ]
  36722. }
  36723. },
  36724. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_3": {
  36725. "hide_name": 0,
  36726. "type": "SB_DFFE",
  36727. "parameters": {
  36728. },
  36729. "attributes": {
  36730. "module_not_derived": "00000000000000000000000000000001",
  36731. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36732. },
  36733. "port_directions": {
  36734. "C": "input",
  36735. "D": "input",
  36736. "E": "input",
  36737. "Q": "output"
  36738. },
  36739. "connections": {
  36740. "C": [ 42 ],
  36741. "D": [ 1283 ],
  36742. "E": [ 1472 ],
  36743. "Q": [ 1546 ]
  36744. }
  36745. },
  36746. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_4": {
  36747. "hide_name": 0,
  36748. "type": "SB_DFFE",
  36749. "parameters": {
  36750. },
  36751. "attributes": {
  36752. "module_not_derived": "00000000000000000000000000000001",
  36753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36754. },
  36755. "port_directions": {
  36756. "C": "input",
  36757. "D": "input",
  36758. "E": "input",
  36759. "Q": "output"
  36760. },
  36761. "connections": {
  36762. "C": [ 42 ],
  36763. "D": [ 1280 ],
  36764. "E": [ 1472 ],
  36765. "Q": [ 1547 ]
  36766. }
  36767. },
  36768. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_5": {
  36769. "hide_name": 0,
  36770. "type": "SB_DFFE",
  36771. "parameters": {
  36772. },
  36773. "attributes": {
  36774. "module_not_derived": "00000000000000000000000000000001",
  36775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36776. },
  36777. "port_directions": {
  36778. "C": "input",
  36779. "D": "input",
  36780. "E": "input",
  36781. "Q": "output"
  36782. },
  36783. "connections": {
  36784. "C": [ 42 ],
  36785. "D": [ 1277 ],
  36786. "E": [ 1472 ],
  36787. "Q": [ 1548 ]
  36788. }
  36789. },
  36790. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_6": {
  36791. "hide_name": 0,
  36792. "type": "SB_DFFE",
  36793. "parameters": {
  36794. },
  36795. "attributes": {
  36796. "module_not_derived": "00000000000000000000000000000001",
  36797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36798. },
  36799. "port_directions": {
  36800. "C": "input",
  36801. "D": "input",
  36802. "E": "input",
  36803. "Q": "output"
  36804. },
  36805. "connections": {
  36806. "C": [ 42 ],
  36807. "D": [ 1301 ],
  36808. "E": [ 1472 ],
  36809. "Q": [ 1549 ]
  36810. }
  36811. },
  36812. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_7": {
  36813. "hide_name": 0,
  36814. "type": "SB_DFFE",
  36815. "parameters": {
  36816. },
  36817. "attributes": {
  36818. "module_not_derived": "00000000000000000000000000000001",
  36819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36820. },
  36821. "port_directions": {
  36822. "C": "input",
  36823. "D": "input",
  36824. "E": "input",
  36825. "Q": "output"
  36826. },
  36827. "connections": {
  36828. "C": [ 42 ],
  36829. "D": [ 1304 ],
  36830. "E": [ 1472 ],
  36831. "Q": [ 1550 ]
  36832. }
  36833. },
  36834. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_8": {
  36835. "hide_name": 0,
  36836. "type": "SB_DFFE",
  36837. "parameters": {
  36838. },
  36839. "attributes": {
  36840. "module_not_derived": "00000000000000000000000000000001",
  36841. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36842. },
  36843. "port_directions": {
  36844. "C": "input",
  36845. "D": "input",
  36846. "E": "input",
  36847. "Q": "output"
  36848. },
  36849. "connections": {
  36850. "C": [ 42 ],
  36851. "D": [ 1307 ],
  36852. "E": [ 1472 ],
  36853. "Q": [ 1551 ]
  36854. }
  36855. },
  36856. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen_SB_DFFE_Q_9": {
  36857. "hide_name": 0,
  36858. "type": "SB_DFFE",
  36859. "parameters": {
  36860. },
  36861. "attributes": {
  36862. "module_not_derived": "00000000000000000000000000000001",
  36863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  36864. },
  36865. "port_directions": {
  36866. "C": "input",
  36867. "D": "input",
  36868. "E": "input",
  36869. "Q": "output"
  36870. },
  36871. "connections": {
  36872. "C": [ 42 ],
  36873. "D": [ 1310 ],
  36874. "E": [ 1472 ],
  36875. "Q": [ 1552 ]
  36876. }
  36877. },
  36878. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_isIoAccess_SB_DFFER_Q": {
  36879. "hide_name": 0,
  36880. "type": "SB_DFFER",
  36881. "parameters": {
  36882. },
  36883. "attributes": {
  36884. "module_not_derived": "00000000000000000000000000000001",
  36885. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  36886. },
  36887. "port_directions": {
  36888. "C": "input",
  36889. "D": "input",
  36890. "E": "input",
  36891. "Q": "output",
  36892. "R": "input"
  36893. },
  36894. "connections": {
  36895. "C": [ 42 ],
  36896. "D": [ 1553 ],
  36897. "E": [ 1474 ],
  36898. "Q": [ 1482 ],
  36899. "R": [ 127 ]
  36900. }
  36901. },
  36902. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_isIoAccess_SB_LUT4_I3": {
  36903. "hide_name": 0,
  36904. "type": "SB_LUT4",
  36905. "parameters": {
  36906. "LUT_INIT": "0000000011001010"
  36907. },
  36908. "attributes": {
  36909. "module_not_derived": "00000000000000000000000000000001",
  36910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  36911. },
  36912. "port_directions": {
  36913. "I0": "input",
  36914. "I1": "input",
  36915. "I2": "input",
  36916. "I3": "input",
  36917. "O": "output"
  36918. },
  36919. "connections": {
  36920. "I0": [ 1554 ],
  36921. "I1": [ 1555 ],
  36922. "I2": [ 1556 ],
  36923. "I3": [ 1482 ],
  36924. "O": [ 1557 ]
  36925. }
  36926. },
  36927. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_valid_SB_LUT4_O": {
  36928. "hide_name": 0,
  36929. "type": "SB_LUT4",
  36930. "parameters": {
  36931. "LUT_INIT": "0000111100000000"
  36932. },
  36933. "attributes": {
  36934. "module_not_derived": "00000000000000000000000000000001",
  36935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  36936. },
  36937. "port_directions": {
  36938. "I0": "input",
  36939. "I1": "input",
  36940. "I2": "input",
  36941. "I3": "input",
  36942. "O": "output"
  36943. },
  36944. "connections": {
  36945. "I0": [ "0" ],
  36946. "I1": [ "0" ],
  36947. "I2": [ 1480 ],
  36948. "I3": [ 1481 ],
  36949. "O": [ 1378 ]
  36950. }
  36951. },
  36952. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_valid_SB_LUT4_O_I3_SB_DFFR_Q": {
  36953. "hide_name": 0,
  36954. "type": "SB_DFFR",
  36955. "parameters": {
  36956. },
  36957. "attributes": {
  36958. "module_not_derived": "00000000000000000000000000000001",
  36959. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  36960. },
  36961. "port_directions": {
  36962. "C": "input",
  36963. "D": "input",
  36964. "Q": "output",
  36965. "R": "input"
  36966. },
  36967. "connections": {
  36968. "C": [ 42 ],
  36969. "D": [ 1558 ],
  36970. "Q": [ 1481 ],
  36971. "R": [ 127 ]
  36972. }
  36973. },
  36974. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_valid_SB_LUT4_O_I3_SB_LUT4_I0": {
  36975. "hide_name": 0,
  36976. "type": "SB_LUT4",
  36977. "parameters": {
  36978. "LUT_INIT": "1111111110000000"
  36979. },
  36980. "attributes": {
  36981. "module_not_derived": "00000000000000000000000000000001",
  36982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  36983. },
  36984. "port_directions": {
  36985. "I0": "input",
  36986. "I1": "input",
  36987. "I2": "input",
  36988. "I3": "input",
  36989. "O": "output"
  36990. },
  36991. "connections": {
  36992. "I0": [ 1481 ],
  36993. "I1": [ 1469 ],
  36994. "I2": [ 1466 ],
  36995. "I3": [ 1473 ],
  36996. "O": [ 1558 ]
  36997. }
  36998. },
  36999. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q": {
  37000. "hide_name": 0,
  37001. "type": "SB_DFFE",
  37002. "parameters": {
  37003. },
  37004. "attributes": {
  37005. "module_not_derived": "00000000000000000000000000000001",
  37006. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37007. },
  37008. "port_directions": {
  37009. "C": "input",
  37010. "D": "input",
  37011. "E": "input",
  37012. "Q": "output"
  37013. },
  37014. "connections": {
  37015. "C": [ 42 ],
  37016. "D": [ 1483 ],
  37017. "E": [ 1378 ],
  37018. "Q": [ 1559 ]
  37019. }
  37020. },
  37021. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_1": {
  37022. "hide_name": 0,
  37023. "type": "SB_DFFE",
  37024. "parameters": {
  37025. },
  37026. "attributes": {
  37027. "module_not_derived": "00000000000000000000000000000001",
  37028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37029. },
  37030. "port_directions": {
  37031. "C": "input",
  37032. "D": "input",
  37033. "E": "input",
  37034. "Q": "output"
  37035. },
  37036. "connections": {
  37037. "C": [ 42 ],
  37038. "D": [ 1485 ],
  37039. "E": [ 1378 ],
  37040. "Q": [ 737 ]
  37041. }
  37042. },
  37043. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_10": {
  37044. "hide_name": 0,
  37045. "type": "SB_DFFE",
  37046. "parameters": {
  37047. },
  37048. "attributes": {
  37049. "module_not_derived": "00000000000000000000000000000001",
  37050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37051. },
  37052. "port_directions": {
  37053. "C": "input",
  37054. "D": "input",
  37055. "E": "input",
  37056. "Q": "output"
  37057. },
  37058. "connections": {
  37059. "C": [ 42 ],
  37060. "D": [ 1487 ],
  37061. "E": [ 1378 ],
  37062. "Q": [ 727 ]
  37063. }
  37064. },
  37065. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_11": {
  37066. "hide_name": 0,
  37067. "type": "SB_DFFE",
  37068. "parameters": {
  37069. },
  37070. "attributes": {
  37071. "module_not_derived": "00000000000000000000000000000001",
  37072. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37073. },
  37074. "port_directions": {
  37075. "C": "input",
  37076. "D": "input",
  37077. "E": "input",
  37078. "Q": "output"
  37079. },
  37080. "connections": {
  37081. "C": [ 42 ],
  37082. "D": [ 1489 ],
  37083. "E": [ 1378 ],
  37084. "Q": [ 725 ]
  37085. }
  37086. },
  37087. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_12": {
  37088. "hide_name": 0,
  37089. "type": "SB_DFFE",
  37090. "parameters": {
  37091. },
  37092. "attributes": {
  37093. "module_not_derived": "00000000000000000000000000000001",
  37094. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37095. },
  37096. "port_directions": {
  37097. "C": "input",
  37098. "D": "input",
  37099. "E": "input",
  37100. "Q": "output"
  37101. },
  37102. "connections": {
  37103. "C": [ 42 ],
  37104. "D": [ 1491 ],
  37105. "E": [ 1378 ],
  37106. "Q": [ 723 ]
  37107. }
  37108. },
  37109. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_13": {
  37110. "hide_name": 0,
  37111. "type": "SB_DFFE",
  37112. "parameters": {
  37113. },
  37114. "attributes": {
  37115. "module_not_derived": "00000000000000000000000000000001",
  37116. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37117. },
  37118. "port_directions": {
  37119. "C": "input",
  37120. "D": "input",
  37121. "E": "input",
  37122. "Q": "output"
  37123. },
  37124. "connections": {
  37125. "C": [ 42 ],
  37126. "D": [ 1493 ],
  37127. "E": [ 1378 ],
  37128. "Q": [ 721 ]
  37129. }
  37130. },
  37131. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_14": {
  37132. "hide_name": 0,
  37133. "type": "SB_DFFE",
  37134. "parameters": {
  37135. },
  37136. "attributes": {
  37137. "module_not_derived": "00000000000000000000000000000001",
  37138. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37139. },
  37140. "port_directions": {
  37141. "C": "input",
  37142. "D": "input",
  37143. "E": "input",
  37144. "Q": "output"
  37145. },
  37146. "connections": {
  37147. "C": [ 42 ],
  37148. "D": [ 1495 ],
  37149. "E": [ 1378 ],
  37150. "Q": [ 719 ]
  37151. }
  37152. },
  37153. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_15": {
  37154. "hide_name": 0,
  37155. "type": "SB_DFFE",
  37156. "parameters": {
  37157. },
  37158. "attributes": {
  37159. "module_not_derived": "00000000000000000000000000000001",
  37160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37161. },
  37162. "port_directions": {
  37163. "C": "input",
  37164. "D": "input",
  37165. "E": "input",
  37166. "Q": "output"
  37167. },
  37168. "connections": {
  37169. "C": [ 42 ],
  37170. "D": [ 1497 ],
  37171. "E": [ 1378 ],
  37172. "Q": [ 709 ]
  37173. }
  37174. },
  37175. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_16": {
  37176. "hide_name": 0,
  37177. "type": "SB_DFFE",
  37178. "parameters": {
  37179. },
  37180. "attributes": {
  37181. "module_not_derived": "00000000000000000000000000000001",
  37182. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37183. },
  37184. "port_directions": {
  37185. "C": "input",
  37186. "D": "input",
  37187. "E": "input",
  37188. "Q": "output"
  37189. },
  37190. "connections": {
  37191. "C": [ 42 ],
  37192. "D": [ 1499 ],
  37193. "E": [ 1378 ],
  37194. "Q": [ 686 ]
  37195. }
  37196. },
  37197. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_17": {
  37198. "hide_name": 0,
  37199. "type": "SB_DFFE",
  37200. "parameters": {
  37201. },
  37202. "attributes": {
  37203. "module_not_derived": "00000000000000000000000000000001",
  37204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37205. },
  37206. "port_directions": {
  37207. "C": "input",
  37208. "D": "input",
  37209. "E": "input",
  37210. "Q": "output"
  37211. },
  37212. "connections": {
  37213. "C": [ 42 ],
  37214. "D": [ 1501 ],
  37215. "E": [ 1378 ],
  37216. "Q": [ 683 ]
  37217. }
  37218. },
  37219. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_18": {
  37220. "hide_name": 0,
  37221. "type": "SB_DFFE",
  37222. "parameters": {
  37223. },
  37224. "attributes": {
  37225. "module_not_derived": "00000000000000000000000000000001",
  37226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37227. },
  37228. "port_directions": {
  37229. "C": "input",
  37230. "D": "input",
  37231. "E": "input",
  37232. "Q": "output"
  37233. },
  37234. "connections": {
  37235. "C": [ 42 ],
  37236. "D": [ 1503 ],
  37237. "E": [ 1378 ],
  37238. "Q": [ 711 ]
  37239. }
  37240. },
  37241. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_19": {
  37242. "hide_name": 0,
  37243. "type": "SB_DFFE",
  37244. "parameters": {
  37245. },
  37246. "attributes": {
  37247. "module_not_derived": "00000000000000000000000000000001",
  37248. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37249. },
  37250. "port_directions": {
  37251. "C": "input",
  37252. "D": "input",
  37253. "E": "input",
  37254. "Q": "output"
  37255. },
  37256. "connections": {
  37257. "C": [ 42 ],
  37258. "D": [ 1505 ],
  37259. "E": [ 1378 ],
  37260. "Q": [ 713 ]
  37261. }
  37262. },
  37263. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_2": {
  37264. "hide_name": 0,
  37265. "type": "SB_DFFE",
  37266. "parameters": {
  37267. },
  37268. "attributes": {
  37269. "module_not_derived": "00000000000000000000000000000001",
  37270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37271. },
  37272. "port_directions": {
  37273. "C": "input",
  37274. "D": "input",
  37275. "E": "input",
  37276. "Q": "output"
  37277. },
  37278. "connections": {
  37279. "C": [ 42 ],
  37280. "D": [ 1507 ],
  37281. "E": [ 1378 ],
  37282. "Q": [ 1560 ]
  37283. }
  37284. },
  37285. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_20": {
  37286. "hide_name": 0,
  37287. "type": "SB_DFFE",
  37288. "parameters": {
  37289. },
  37290. "attributes": {
  37291. "module_not_derived": "00000000000000000000000000000001",
  37292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37293. },
  37294. "port_directions": {
  37295. "C": "input",
  37296. "D": "input",
  37297. "E": "input",
  37298. "Q": "output"
  37299. },
  37300. "connections": {
  37301. "C": [ 42 ],
  37302. "D": [ 1509 ],
  37303. "E": [ 1378 ],
  37304. "Q": [ 715 ]
  37305. }
  37306. },
  37307. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_21": {
  37308. "hide_name": 0,
  37309. "type": "SB_DFFE",
  37310. "parameters": {
  37311. },
  37312. "attributes": {
  37313. "module_not_derived": "00000000000000000000000000000001",
  37314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37315. },
  37316. "port_directions": {
  37317. "C": "input",
  37318. "D": "input",
  37319. "E": "input",
  37320. "Q": "output"
  37321. },
  37322. "connections": {
  37323. "C": [ 42 ],
  37324. "D": [ 1432 ],
  37325. "E": [ 1378 ],
  37326. "Q": [ 717 ]
  37327. }
  37328. },
  37329. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_22": {
  37330. "hide_name": 0,
  37331. "type": "SB_DFFE",
  37332. "parameters": {
  37333. },
  37334. "attributes": {
  37335. "module_not_derived": "00000000000000000000000000000001",
  37336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37337. },
  37338. "port_directions": {
  37339. "C": "input",
  37340. "D": "input",
  37341. "E": "input",
  37342. "Q": "output"
  37343. },
  37344. "connections": {
  37345. "C": [ 42 ],
  37346. "D": [ 1377 ],
  37347. "E": [ 1378 ],
  37348. "Q": [ 692 ]
  37349. }
  37350. },
  37351. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_23": {
  37352. "hide_name": 0,
  37353. "type": "SB_DFFE",
  37354. "parameters": {
  37355. },
  37356. "attributes": {
  37357. "module_not_derived": "00000000000000000000000000000001",
  37358. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37359. },
  37360. "port_directions": {
  37361. "C": "input",
  37362. "D": "input",
  37363. "E": "input",
  37364. "Q": "output"
  37365. },
  37366. "connections": {
  37367. "C": [ 42 ],
  37368. "D": [ 1394 ],
  37369. "E": [ 1378 ],
  37370. "Q": [ 694 ]
  37371. }
  37372. },
  37373. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_24": {
  37374. "hide_name": 0,
  37375. "type": "SB_DFFE",
  37376. "parameters": {
  37377. },
  37378. "attributes": {
  37379. "module_not_derived": "00000000000000000000000000000001",
  37380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37381. },
  37382. "port_directions": {
  37383. "C": "input",
  37384. "D": "input",
  37385. "E": "input",
  37386. "Q": "output"
  37387. },
  37388. "connections": {
  37389. "C": [ 42 ],
  37390. "D": [ 1404 ],
  37391. "E": [ 1378 ],
  37392. "Q": [ 696 ]
  37393. }
  37394. },
  37395. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_25": {
  37396. "hide_name": 0,
  37397. "type": "SB_DFFE",
  37398. "parameters": {
  37399. },
  37400. "attributes": {
  37401. "module_not_derived": "00000000000000000000000000000001",
  37402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37403. },
  37404. "port_directions": {
  37405. "C": "input",
  37406. "D": "input",
  37407. "E": "input",
  37408. "Q": "output"
  37409. },
  37410. "connections": {
  37411. "C": [ 42 ],
  37412. "D": [ 1414 ],
  37413. "E": [ 1378 ],
  37414. "Q": [ 698 ]
  37415. }
  37416. },
  37417. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_26": {
  37418. "hide_name": 0,
  37419. "type": "SB_DFFE",
  37420. "parameters": {
  37421. },
  37422. "attributes": {
  37423. "module_not_derived": "00000000000000000000000000000001",
  37424. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37425. },
  37426. "port_directions": {
  37427. "C": "input",
  37428. "D": "input",
  37429. "E": "input",
  37430. "Q": "output"
  37431. },
  37432. "connections": {
  37433. "C": [ 42 ],
  37434. "D": [ 1422 ],
  37435. "E": [ 1378 ],
  37436. "Q": [ 700 ]
  37437. }
  37438. },
  37439. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_27": {
  37440. "hide_name": 0,
  37441. "type": "SB_DFFE",
  37442. "parameters": {
  37443. },
  37444. "attributes": {
  37445. "module_not_derived": "00000000000000000000000000000001",
  37446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37447. },
  37448. "port_directions": {
  37449. "C": "input",
  37450. "D": "input",
  37451. "E": "input",
  37452. "Q": "output"
  37453. },
  37454. "connections": {
  37455. "C": [ 42 ],
  37456. "D": [ 1446 ],
  37457. "E": [ 1378 ],
  37458. "Q": [ 1561 ]
  37459. }
  37460. },
  37461. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_28": {
  37462. "hide_name": 0,
  37463. "type": "SB_DFFE",
  37464. "parameters": {
  37465. },
  37466. "attributes": {
  37467. "module_not_derived": "00000000000000000000000000000001",
  37468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37469. },
  37470. "port_directions": {
  37471. "C": "input",
  37472. "D": "input",
  37473. "E": "input",
  37474. "Q": "output"
  37475. },
  37476. "connections": {
  37477. "C": [ 42 ],
  37478. "D": [ 1457 ],
  37479. "E": [ 1378 ],
  37480. "Q": [ 1562 ]
  37481. }
  37482. },
  37483. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_29": {
  37484. "hide_name": 0,
  37485. "type": "SB_DFFE",
  37486. "parameters": {
  37487. },
  37488. "attributes": {
  37489. "module_not_derived": "00000000000000000000000000000001",
  37490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37491. },
  37492. "port_directions": {
  37493. "C": "input",
  37494. "D": "input",
  37495. "E": "input",
  37496. "Q": "output"
  37497. },
  37498. "connections": {
  37499. "C": [ 42 ],
  37500. "D": [ 1461 ],
  37501. "E": [ 1378 ],
  37502. "Q": [ 1563 ]
  37503. }
  37504. },
  37505. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_3": {
  37506. "hide_name": 0,
  37507. "type": "SB_DFFE",
  37508. "parameters": {
  37509. },
  37510. "attributes": {
  37511. "module_not_derived": "00000000000000000000000000000001",
  37512. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37513. },
  37514. "port_directions": {
  37515. "C": "input",
  37516. "D": "input",
  37517. "E": "input",
  37518. "Q": "output"
  37519. },
  37520. "connections": {
  37521. "C": [ 42 ],
  37522. "D": [ 1511 ],
  37523. "E": [ 1378 ],
  37524. "Q": [ 1564 ]
  37525. }
  37526. },
  37527. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_4": {
  37528. "hide_name": 0,
  37529. "type": "SB_DFFE",
  37530. "parameters": {
  37531. },
  37532. "attributes": {
  37533. "module_not_derived": "00000000000000000000000000000001",
  37534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37535. },
  37536. "port_directions": {
  37537. "C": "input",
  37538. "D": "input",
  37539. "E": "input",
  37540. "Q": "output"
  37541. },
  37542. "connections": {
  37543. "C": [ 42 ],
  37544. "D": [ 1513 ],
  37545. "E": [ 1378 ],
  37546. "Q": [ 1565 ]
  37547. }
  37548. },
  37549. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_5": {
  37550. "hide_name": 0,
  37551. "type": "SB_DFFE",
  37552. "parameters": {
  37553. },
  37554. "attributes": {
  37555. "module_not_derived": "00000000000000000000000000000001",
  37556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37557. },
  37558. "port_directions": {
  37559. "C": "input",
  37560. "D": "input",
  37561. "E": "input",
  37562. "Q": "output"
  37563. },
  37564. "connections": {
  37565. "C": [ 42 ],
  37566. "D": [ 1515 ],
  37567. "E": [ 1378 ],
  37568. "Q": [ 1566 ]
  37569. }
  37570. },
  37571. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_6": {
  37572. "hide_name": 0,
  37573. "type": "SB_DFFE",
  37574. "parameters": {
  37575. },
  37576. "attributes": {
  37577. "module_not_derived": "00000000000000000000000000000001",
  37578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37579. },
  37580. "port_directions": {
  37581. "C": "input",
  37582. "D": "input",
  37583. "E": "input",
  37584. "Q": "output"
  37585. },
  37586. "connections": {
  37587. "C": [ 42 ],
  37588. "D": [ 1517 ],
  37589. "E": [ 1378 ],
  37590. "Q": [ 690 ]
  37591. }
  37592. },
  37593. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_7": {
  37594. "hide_name": 0,
  37595. "type": "SB_DFFE",
  37596. "parameters": {
  37597. },
  37598. "attributes": {
  37599. "module_not_derived": "00000000000000000000000000000001",
  37600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37601. },
  37602. "port_directions": {
  37603. "C": "input",
  37604. "D": "input",
  37605. "E": "input",
  37606. "Q": "output"
  37607. },
  37608. "connections": {
  37609. "C": [ 42 ],
  37610. "D": [ 1519 ],
  37611. "E": [ 1378 ],
  37612. "Q": [ 688 ]
  37613. }
  37614. },
  37615. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_8": {
  37616. "hide_name": 0,
  37617. "type": "SB_DFFE",
  37618. "parameters": {
  37619. },
  37620. "attributes": {
  37621. "module_not_derived": "00000000000000000000000000000001",
  37622. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37623. },
  37624. "port_directions": {
  37625. "C": "input",
  37626. "D": "input",
  37627. "E": "input",
  37628. "Q": "output"
  37629. },
  37630. "connections": {
  37631. "C": [ 42 ],
  37632. "D": [ 1521 ],
  37633. "E": [ 1378 ],
  37634. "Q": [ 731 ]
  37635. }
  37636. },
  37637. "cpu_I.IBusCachedPlugin_cache.lineLoader_address_SB_DFFE_Q_9": {
  37638. "hide_name": 0,
  37639. "type": "SB_DFFE",
  37640. "parameters": {
  37641. },
  37642. "attributes": {
  37643. "module_not_derived": "00000000000000000000000000000001",
  37644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  37645. },
  37646. "port_directions": {
  37647. "C": "input",
  37648. "D": "input",
  37649. "E": "input",
  37650. "Q": "output"
  37651. },
  37652. "connections": {
  37653. "C": [ 42 ],
  37654. "D": [ 1523 ],
  37655. "E": [ 1378 ],
  37656. "Q": [ 729 ]
  37657. }
  37658. },
  37659. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q": {
  37660. "hide_name": 0,
  37661. "type": "SB_DFFESR",
  37662. "parameters": {
  37663. },
  37664. "attributes": {
  37665. "module_not_derived": "00000000000000000000000000000001",
  37666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  37667. },
  37668. "port_directions": {
  37669. "C": "input",
  37670. "D": "input",
  37671. "E": "input",
  37672. "Q": "output",
  37673. "R": "input"
  37674. },
  37675. "connections": {
  37676. "C": [ 42 ],
  37677. "D": [ 1567 ],
  37678. "E": [ 1476 ],
  37679. "Q": [ 1568 ],
  37680. "R": [ 1359 ]
  37681. }
  37682. },
  37683. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q_1": {
  37684. "hide_name": 0,
  37685. "type": "SB_DFFESR",
  37686. "parameters": {
  37687. },
  37688. "attributes": {
  37689. "module_not_derived": "00000000000000000000000000000001",
  37690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  37691. },
  37692. "port_directions": {
  37693. "C": "input",
  37694. "D": "input",
  37695. "E": "input",
  37696. "Q": "output",
  37697. "R": "input"
  37698. },
  37699. "connections": {
  37700. "C": [ 42 ],
  37701. "D": [ 1569 ],
  37702. "E": [ 1476 ],
  37703. "Q": [ 1570 ],
  37704. "R": [ 1359 ]
  37705. }
  37706. },
  37707. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q_2": {
  37708. "hide_name": 0,
  37709. "type": "SB_DFFESR",
  37710. "parameters": {
  37711. },
  37712. "attributes": {
  37713. "module_not_derived": "00000000000000000000000000000001",
  37714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  37715. },
  37716. "port_directions": {
  37717. "C": "input",
  37718. "D": "input",
  37719. "E": "input",
  37720. "Q": "output",
  37721. "R": "input"
  37722. },
  37723. "connections": {
  37724. "C": [ 42 ],
  37725. "D": [ 1571 ],
  37726. "E": [ 1476 ],
  37727. "Q": [ 1572 ],
  37728. "R": [ 1359 ]
  37729. }
  37730. },
  37731. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q_3": {
  37732. "hide_name": 0,
  37733. "type": "SB_DFFESR",
  37734. "parameters": {
  37735. },
  37736. "attributes": {
  37737. "module_not_derived": "00000000000000000000000000000001",
  37738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  37739. },
  37740. "port_directions": {
  37741. "C": "input",
  37742. "D": "input",
  37743. "E": "input",
  37744. "Q": "output",
  37745. "R": "input"
  37746. },
  37747. "connections": {
  37748. "C": [ 42 ],
  37749. "D": [ 1573 ],
  37750. "E": [ 1476 ],
  37751. "Q": [ 1574 ],
  37752. "R": [ 1359 ]
  37753. }
  37754. },
  37755. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q_4": {
  37756. "hide_name": 0,
  37757. "type": "SB_DFFESR",
  37758. "parameters": {
  37759. },
  37760. "attributes": {
  37761. "module_not_derived": "00000000000000000000000000000001",
  37762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  37763. },
  37764. "port_directions": {
  37765. "C": "input",
  37766. "D": "input",
  37767. "E": "input",
  37768. "Q": "output",
  37769. "R": "input"
  37770. },
  37771. "connections": {
  37772. "C": [ 42 ],
  37773. "D": [ 1575 ],
  37774. "E": [ 1476 ],
  37775. "Q": [ 1576 ],
  37776. "R": [ 1359 ]
  37777. }
  37778. },
  37779. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q_5": {
  37780. "hide_name": 0,
  37781. "type": "SB_DFFESR",
  37782. "parameters": {
  37783. },
  37784. "attributes": {
  37785. "module_not_derived": "00000000000000000000000000000001",
  37786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  37787. },
  37788. "port_directions": {
  37789. "C": "input",
  37790. "D": "input",
  37791. "E": "input",
  37792. "Q": "output",
  37793. "R": "input"
  37794. },
  37795. "connections": {
  37796. "C": [ 42 ],
  37797. "D": [ 1577 ],
  37798. "E": [ 1476 ],
  37799. "Q": [ 1578 ],
  37800. "R": [ 1359 ]
  37801. }
  37802. },
  37803. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q": {
  37804. "hide_name": 0,
  37805. "type": "SB_DFFR",
  37806. "parameters": {
  37807. },
  37808. "attributes": {
  37809. "module_not_derived": "00000000000000000000000000000001",
  37810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:264.3-300.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  37811. },
  37812. "port_directions": {
  37813. "C": "input",
  37814. "D": "input",
  37815. "Q": "output",
  37816. "R": "input"
  37817. },
  37818. "connections": {
  37819. "C": [ 42 ],
  37820. "D": [ 1579 ],
  37821. "Q": [ 1580 ],
  37822. "R": [ 127 ]
  37823. }
  37824. },
  37825. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_1": {
  37826. "hide_name": 0,
  37827. "type": "SB_DFFR",
  37828. "parameters": {
  37829. },
  37830. "attributes": {
  37831. "module_not_derived": "00000000000000000000000000000001",
  37832. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:264.3-300.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  37833. },
  37834. "port_directions": {
  37835. "C": "input",
  37836. "D": "input",
  37837. "Q": "output",
  37838. "R": "input"
  37839. },
  37840. "connections": {
  37841. "C": [ 42 ],
  37842. "D": [ 1581 ],
  37843. "Q": [ 1582 ],
  37844. "R": [ 127 ]
  37845. }
  37846. },
  37847. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_1_D_SB_LUT4_O": {
  37848. "hide_name": 0,
  37849. "type": "SB_LUT4",
  37850. "parameters": {
  37851. "LUT_INIT": "0101101011110000"
  37852. },
  37853. "attributes": {
  37854. "module_not_derived": "00000000000000000000000000000001",
  37855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:294.34-294.65|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  37856. },
  37857. "port_directions": {
  37858. "I0": "input",
  37859. "I1": "input",
  37860. "I2": "input",
  37861. "I3": "input",
  37862. "O": "output"
  37863. },
  37864. "connections": {
  37865. "I0": [ 843 ],
  37866. "I1": [ "0" ],
  37867. "I2": [ 1582 ],
  37868. "I3": [ 1583 ],
  37869. "O": [ 1581 ]
  37870. }
  37871. },
  37872. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_2": {
  37873. "hide_name": 0,
  37874. "type": "SB_DFFR",
  37875. "parameters": {
  37876. },
  37877. "attributes": {
  37878. "module_not_derived": "00000000000000000000000000000001",
  37879. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:264.3-300.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  37880. },
  37881. "port_directions": {
  37882. "C": "input",
  37883. "D": "input",
  37884. "Q": "output",
  37885. "R": "input"
  37886. },
  37887. "connections": {
  37888. "C": [ 42 ],
  37889. "D": [ 1584 ],
  37890. "Q": [ 1583 ],
  37891. "R": [ 127 ]
  37892. }
  37893. },
  37894. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_2_D_SB_LUT4_O": {
  37895. "hide_name": 0,
  37896. "type": "SB_LUT4",
  37897. "parameters": {
  37898. "LUT_INIT": "0000111111110000"
  37899. },
  37900. "attributes": {
  37901. "module_not_derived": "00000000000000000000000000000001",
  37902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  37903. },
  37904. "port_directions": {
  37905. "I0": "input",
  37906. "I1": "input",
  37907. "I2": "input",
  37908. "I3": "input",
  37909. "O": "output"
  37910. },
  37911. "connections": {
  37912. "I0": [ "0" ],
  37913. "I1": [ "0" ],
  37914. "I2": [ 1583 ],
  37915. "I3": [ 843 ],
  37916. "O": [ 1584 ]
  37917. }
  37918. },
  37919. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_D_SB_LUT4_O": {
  37920. "hide_name": 0,
  37921. "type": "SB_LUT4",
  37922. "parameters": {
  37923. "LUT_INIT": "0101101011110000"
  37924. },
  37925. "attributes": {
  37926. "module_not_derived": "00000000000000000000000000000001",
  37927. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:294.34-294.65|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  37928. },
  37929. "port_directions": {
  37930. "I0": "input",
  37931. "I1": "input",
  37932. "I2": "input",
  37933. "I3": "input",
  37934. "O": "output"
  37935. },
  37936. "connections": {
  37937. "I0": [ 843 ],
  37938. "I1": [ "0" ],
  37939. "I2": [ 1580 ],
  37940. "I3": [ 1585 ],
  37941. "O": [ 1579 ]
  37942. }
  37943. },
  37944. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO": {
  37945. "hide_name": 0,
  37946. "type": "SB_CARRY",
  37947. "parameters": {
  37948. },
  37949. "attributes": {
  37950. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:294.34-294.65|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  37951. },
  37952. "port_directions": {
  37953. "CI": "input",
  37954. "CO": "output",
  37955. "I0": "input",
  37956. "I1": "input"
  37957. },
  37958. "connections": {
  37959. "CI": [ 1583 ],
  37960. "CO": [ 1585 ],
  37961. "I0": [ "0" ],
  37962. "I1": [ 1582 ]
  37963. }
  37964. },
  37965. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFF_D": {
  37966. "hide_name": 0,
  37967. "type": "SB_DFF",
  37968. "parameters": {
  37969. },
  37970. "attributes": {
  37971. "module_not_derived": "00000000000000000000000000000001",
  37972. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  37973. },
  37974. "port_directions": {
  37975. "C": "input",
  37976. "D": "input",
  37977. "Q": "output"
  37978. },
  37979. "connections": {
  37980. "C": [ 42 ],
  37981. "D": [ 1583 ],
  37982. "Q": [ 1586 ]
  37983. }
  37984. },
  37985. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address_SB_LUT4_O": {
  37986. "hide_name": 0,
  37987. "type": "SB_LUT4",
  37988. "parameters": {
  37989. "LUT_INIT": "1100110011110000"
  37990. },
  37991. "attributes": {
  37992. "module_not_derived": "00000000000000000000000000000001",
  37993. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  37994. },
  37995. "port_directions": {
  37996. "I0": "input",
  37997. "I1": "input",
  37998. "I2": "input",
  37999. "I3": "input",
  38000. "O": "output"
  38001. },
  38002. "connections": {
  38003. "I0": [ "0" ],
  38004. "I1": [ 698 ],
  38005. "I2": [ 1576 ],
  38006. "I3": [ 1353 ],
  38007. "O": [ 1587 ]
  38008. }
  38009. },
  38010. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address_SB_LUT4_O_1": {
  38011. "hide_name": 0,
  38012. "type": "SB_LUT4",
  38013. "parameters": {
  38014. "LUT_INIT": "1100110011110000"
  38015. },
  38016. "attributes": {
  38017. "module_not_derived": "00000000000000000000000000000001",
  38018. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38019. },
  38020. "port_directions": {
  38021. "I0": "input",
  38022. "I1": "input",
  38023. "I2": "input",
  38024. "I3": "input",
  38025. "O": "output"
  38026. },
  38027. "connections": {
  38028. "I0": [ "0" ],
  38029. "I1": [ 696 ],
  38030. "I2": [ 1574 ],
  38031. "I3": [ 1353 ],
  38032. "O": [ 1588 ]
  38033. }
  38034. },
  38035. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address_SB_LUT4_O_2": {
  38036. "hide_name": 0,
  38037. "type": "SB_LUT4",
  38038. "parameters": {
  38039. "LUT_INIT": "1100110011110000"
  38040. },
  38041. "attributes": {
  38042. "module_not_derived": "00000000000000000000000000000001",
  38043. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38044. },
  38045. "port_directions": {
  38046. "I0": "input",
  38047. "I1": "input",
  38048. "I2": "input",
  38049. "I3": "input",
  38050. "O": "output"
  38051. },
  38052. "connections": {
  38053. "I0": [ "0" ],
  38054. "I1": [ 694 ],
  38055. "I2": [ 1572 ],
  38056. "I3": [ 1353 ],
  38057. "O": [ 1589 ]
  38058. }
  38059. },
  38060. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address_SB_LUT4_O_3": {
  38061. "hide_name": 0,
  38062. "type": "SB_LUT4",
  38063. "parameters": {
  38064. "LUT_INIT": "1100110011110000"
  38065. },
  38066. "attributes": {
  38067. "module_not_derived": "00000000000000000000000000000001",
  38068. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38069. },
  38070. "port_directions": {
  38071. "I0": "input",
  38072. "I1": "input",
  38073. "I2": "input",
  38074. "I3": "input",
  38075. "O": "output"
  38076. },
  38077. "connections": {
  38078. "I0": [ "0" ],
  38079. "I1": [ 692 ],
  38080. "I2": [ 1570 ],
  38081. "I3": [ 1353 ],
  38082. "O": [ 1590 ]
  38083. }
  38084. },
  38085. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address_SB_LUT4_O_4": {
  38086. "hide_name": 0,
  38087. "type": "SB_LUT4",
  38088. "parameters": {
  38089. "LUT_INIT": "1100110011110000"
  38090. },
  38091. "attributes": {
  38092. "module_not_derived": "00000000000000000000000000000001",
  38093. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38094. },
  38095. "port_directions": {
  38096. "I0": "input",
  38097. "I1": "input",
  38098. "I2": "input",
  38099. "I3": "input",
  38100. "O": "output"
  38101. },
  38102. "connections": {
  38103. "I0": [ "0" ],
  38104. "I1": [ 717 ],
  38105. "I2": [ 1568 ],
  38106. "I3": [ 1353 ],
  38107. "O": [ 1591 ]
  38108. }
  38109. },
  38110. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address_SB_LUT4_O_5": {
  38111. "hide_name": 0,
  38112. "type": "SB_LUT4",
  38113. "parameters": {
  38114. "LUT_INIT": "1100110011110000"
  38115. },
  38116. "attributes": {
  38117. "module_not_derived": "00000000000000000000000000000001",
  38118. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38119. },
  38120. "port_directions": {
  38121. "I0": "input",
  38122. "I1": "input",
  38123. "I2": "input",
  38124. "I3": "input",
  38125. "O": "output"
  38126. },
  38127. "connections": {
  38128. "I0": [ "0" ],
  38129. "I1": [ 700 ],
  38130. "I2": [ 1578 ],
  38131. "I3": [ 1353 ],
  38132. "O": [ 1592 ]
  38133. }
  38134. },
  38135. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q": {
  38136. "hide_name": 0,
  38137. "type": "SB_DFFSR",
  38138. "parameters": {
  38139. },
  38140. "attributes": {
  38141. "module_not_derived": "00000000000000000000000000000001",
  38142. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  38143. },
  38144. "port_directions": {
  38145. "C": "input",
  38146. "D": "input",
  38147. "Q": "output",
  38148. "R": "input"
  38149. },
  38150. "connections": {
  38151. "C": [ 42 ],
  38152. "D": [ 1593 ],
  38153. "Q": [ 1353 ],
  38154. "R": [ 1359 ]
  38155. }
  38156. },
  38157. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O": {
  38158. "hide_name": 0,
  38159. "type": "SB_LUT4",
  38160. "parameters": {
  38161. "LUT_INIT": "1111111111110000"
  38162. },
  38163. "attributes": {
  38164. "module_not_derived": "00000000000000000000000000000001",
  38165. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38166. },
  38167. "port_directions": {
  38168. "I0": "input",
  38169. "I1": "input",
  38170. "I2": "input",
  38171. "I3": "input",
  38172. "O": "output"
  38173. },
  38174. "connections": {
  38175. "I0": [ "0" ],
  38176. "I1": [ "0" ],
  38177. "I2": [ 1353 ],
  38178. "I3": [ 1594 ],
  38179. "O": [ 1593 ]
  38180. }
  38181. },
  38182. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO": {
  38183. "hide_name": 0,
  38184. "type": "SB_CARRY",
  38185. "parameters": {
  38186. },
  38187. "attributes": {
  38188. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  38189. },
  38190. "port_directions": {
  38191. "CI": "input",
  38192. "CO": "output",
  38193. "I0": "input",
  38194. "I1": "input"
  38195. },
  38196. "connections": {
  38197. "CI": [ 1595 ],
  38198. "CO": [ 1594 ],
  38199. "I0": [ "0" ],
  38200. "I1": [ 1568 ]
  38201. }
  38202. },
  38203. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  38204. "hide_name": 0,
  38205. "type": "SB_CARRY",
  38206. "parameters": {
  38207. },
  38208. "attributes": {
  38209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  38210. },
  38211. "port_directions": {
  38212. "CI": "input",
  38213. "CO": "output",
  38214. "I0": "input",
  38215. "I1": "input"
  38216. },
  38217. "connections": {
  38218. "CI": [ 1596 ],
  38219. "CO": [ 1595 ],
  38220. "I0": [ "0" ],
  38221. "I1": [ 1570 ]
  38222. }
  38223. },
  38224. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  38225. "hide_name": 0,
  38226. "type": "SB_CARRY",
  38227. "parameters": {
  38228. },
  38229. "attributes": {
  38230. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  38231. },
  38232. "port_directions": {
  38233. "CI": "input",
  38234. "CO": "output",
  38235. "I0": "input",
  38236. "I1": "input"
  38237. },
  38238. "connections": {
  38239. "CI": [ 1597 ],
  38240. "CO": [ 1596 ],
  38241. "I0": [ "0" ],
  38242. "I1": [ 1572 ]
  38243. }
  38244. },
  38245. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3": {
  38246. "hide_name": 0,
  38247. "type": "SB_LUT4",
  38248. "parameters": {
  38249. "LUT_INIT": "0110100110010110"
  38250. },
  38251. "attributes": {
  38252. "module_not_derived": "00000000000000000000000000000001",
  38253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38254. },
  38255. "port_directions": {
  38256. "I0": "input",
  38257. "I1": "input",
  38258. "I2": "input",
  38259. "I3": "input",
  38260. "O": "output"
  38261. },
  38262. "connections": {
  38263. "I0": [ "0" ],
  38264. "I1": [ "0" ],
  38265. "I2": [ 1568 ],
  38266. "I3": [ 1595 ],
  38267. "O": [ 1567 ]
  38268. }
  38269. },
  38270. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O": {
  38271. "hide_name": 0,
  38272. "type": "SB_LUT4",
  38273. "parameters": {
  38274. "LUT_INIT": "0110100110010110"
  38275. },
  38276. "attributes": {
  38277. "module_not_derived": "00000000000000000000000000000001",
  38278. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38279. },
  38280. "port_directions": {
  38281. "I0": "input",
  38282. "I1": "input",
  38283. "I2": "input",
  38284. "I3": "input",
  38285. "O": "output"
  38286. },
  38287. "connections": {
  38288. "I0": [ "0" ],
  38289. "I1": [ "0" ],
  38290. "I2": [ 1574 ],
  38291. "I3": [ 1598 ],
  38292. "O": [ 1573 ]
  38293. }
  38294. },
  38295. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_1": {
  38296. "hide_name": 0,
  38297. "type": "SB_LUT4",
  38298. "parameters": {
  38299. "LUT_INIT": "0110100110010110"
  38300. },
  38301. "attributes": {
  38302. "module_not_derived": "00000000000000000000000000000001",
  38303. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38304. },
  38305. "port_directions": {
  38306. "I0": "input",
  38307. "I1": "input",
  38308. "I2": "input",
  38309. "I3": "input",
  38310. "O": "output"
  38311. },
  38312. "connections": {
  38313. "I0": [ "0" ],
  38314. "I1": [ "0" ],
  38315. "I2": [ 1576 ],
  38316. "I3": [ 1578 ],
  38317. "O": [ 1575 ]
  38318. }
  38319. },
  38320. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_2": {
  38321. "hide_name": 0,
  38322. "type": "SB_LUT4",
  38323. "parameters": {
  38324. "LUT_INIT": "0110100110010110"
  38325. },
  38326. "attributes": {
  38327. "module_not_derived": "00000000000000000000000000000001",
  38328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38329. },
  38330. "port_directions": {
  38331. "I0": "input",
  38332. "I1": "input",
  38333. "I2": "input",
  38334. "I3": "input",
  38335. "O": "output"
  38336. },
  38337. "connections": {
  38338. "I0": [ "0" ],
  38339. "I1": [ "0" ],
  38340. "I2": [ 1572 ],
  38341. "I3": [ 1597 ],
  38342. "O": [ 1571 ]
  38343. }
  38344. },
  38345. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  38346. "hide_name": 0,
  38347. "type": "SB_CARRY",
  38348. "parameters": {
  38349. },
  38350. "attributes": {
  38351. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  38352. },
  38353. "port_directions": {
  38354. "CI": "input",
  38355. "CO": "output",
  38356. "I0": "input",
  38357. "I1": "input"
  38358. },
  38359. "connections": {
  38360. "CI": [ 1598 ],
  38361. "CO": [ 1597 ],
  38362. "I0": [ "0" ],
  38363. "I1": [ 1574 ]
  38364. }
  38365. },
  38366. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_3": {
  38367. "hide_name": 0,
  38368. "type": "SB_LUT4",
  38369. "parameters": {
  38370. "LUT_INIT": "0110100110010110"
  38371. },
  38372. "attributes": {
  38373. "module_not_derived": "00000000000000000000000000000001",
  38374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38375. },
  38376. "port_directions": {
  38377. "I0": "input",
  38378. "I1": "input",
  38379. "I2": "input",
  38380. "I3": "input",
  38381. "O": "output"
  38382. },
  38383. "connections": {
  38384. "I0": [ "0" ],
  38385. "I1": [ "0" ],
  38386. "I2": [ 1570 ],
  38387. "I3": [ 1596 ],
  38388. "O": [ 1569 ]
  38389. }
  38390. },
  38391. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_4": {
  38392. "hide_name": 0,
  38393. "type": "SB_LUT4",
  38394. "parameters": {
  38395. "LUT_INIT": "0000000011111111"
  38396. },
  38397. "attributes": {
  38398. "module_not_derived": "00000000000000000000000000000001",
  38399. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  38400. },
  38401. "port_directions": {
  38402. "I0": "input",
  38403. "I1": "input",
  38404. "I2": "input",
  38405. "I3": "input",
  38406. "O": "output"
  38407. },
  38408. "connections": {
  38409. "I0": [ "0" ],
  38410. "I1": [ "0" ],
  38411. "I2": [ "0" ],
  38412. "I3": [ 1578 ],
  38413. "O": [ 1577 ]
  38414. }
  38415. },
  38416. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_CARRY_CO": {
  38417. "hide_name": 0,
  38418. "type": "SB_CARRY",
  38419. "parameters": {
  38420. },
  38421. "attributes": {
  38422. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  38423. },
  38424. "port_directions": {
  38425. "CI": "input",
  38426. "CO": "output",
  38427. "I0": "input",
  38428. "I1": "input"
  38429. },
  38430. "connections": {
  38431. "CI": [ 1578 ],
  38432. "CO": [ 1598 ],
  38433. "I0": [ "0" ],
  38434. "I1": [ 1576 ]
  38435. }
  38436. },
  38437. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_DFF_D": {
  38438. "hide_name": 0,
  38439. "type": "SB_DFF",
  38440. "parameters": {
  38441. },
  38442. "attributes": {
  38443. "module_not_derived": "00000000000000000000000000000001",
  38444. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  38445. },
  38446. "port_directions": {
  38447. "C": "input",
  38448. "D": "input",
  38449. "Q": "output"
  38450. },
  38451. "connections": {
  38452. "C": [ 42 ],
  38453. "D": [ 1599 ],
  38454. "Q": [ 1600 ]
  38455. }
  38456. },
  38457. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_DFF_D_Q_SB_LUT4_I3": {
  38458. "hide_name": 0,
  38459. "type": "SB_LUT4",
  38460. "parameters": {
  38461. "LUT_INIT": "0000000011111111"
  38462. },
  38463. "attributes": {
  38464. "module_not_derived": "00000000000000000000000000000001",
  38465. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  38466. },
  38467. "port_directions": {
  38468. "I0": "input",
  38469. "I1": "input",
  38470. "I2": "input",
  38471. "I3": "input",
  38472. "O": "output"
  38473. },
  38474. "connections": {
  38475. "I0": [ "0" ],
  38476. "I1": [ "0" ],
  38477. "I2": [ "0" ],
  38478. "I3": [ 1600 ],
  38479. "O": [ 1601 ]
  38480. }
  38481. },
  38482. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O": {
  38483. "hide_name": 0,
  38484. "type": "SB_LUT4",
  38485. "parameters": {
  38486. "LUT_INIT": "1111111100001111"
  38487. },
  38488. "attributes": {
  38489. "module_not_derived": "00000000000000000000000000000001",
  38490. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  38491. },
  38492. "port_directions": {
  38493. "I0": "input",
  38494. "I1": "input",
  38495. "I2": "input",
  38496. "I3": "input",
  38497. "O": "output"
  38498. },
  38499. "connections": {
  38500. "I0": [ "0" ],
  38501. "I1": [ "0" ],
  38502. "I2": [ 1353 ],
  38503. "I3": [ 1602 ],
  38504. "O": [ 1599 ]
  38505. }
  38506. },
  38507. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3": {
  38508. "hide_name": 0,
  38509. "type": "SB_LUT4",
  38510. "parameters": {
  38511. "LUT_INIT": "1111000011111100"
  38512. },
  38513. "attributes": {
  38514. "module_not_derived": "00000000000000000000000000000001",
  38515. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38516. },
  38517. "port_directions": {
  38518. "I0": "input",
  38519. "I1": "input",
  38520. "I2": "input",
  38521. "I3": "input",
  38522. "O": "output"
  38523. },
  38524. "connections": {
  38525. "I0": [ "0" ],
  38526. "I1": [ 842 ],
  38527. "I2": [ 1378 ],
  38528. "I3": [ 1602 ],
  38529. "O": [ 1603 ]
  38530. }
  38531. },
  38532. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  38533. "hide_name": 0,
  38534. "type": "SB_LUT4",
  38535. "parameters": {
  38536. "LUT_INIT": "0000000011111100"
  38537. },
  38538. "attributes": {
  38539. "module_not_derived": "00000000000000000000000000000001",
  38540. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  38541. },
  38542. "port_directions": {
  38543. "I0": "input",
  38544. "I1": "input",
  38545. "I2": "input",
  38546. "I3": "input",
  38547. "O": "output"
  38548. },
  38549. "connections": {
  38550. "I0": [ "0" ],
  38551. "I1": [ 841 ],
  38552. "I2": [ 1604 ],
  38553. "I3": [ 1602 ],
  38554. "O": [ 1605 ]
  38555. }
  38556. },
  38557. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_1_I2_SB_LUT4_O": {
  38558. "hide_name": 0,
  38559. "type": "SB_LUT4",
  38560. "parameters": {
  38561. "LUT_INIT": "1011000010000000"
  38562. },
  38563. "attributes": {
  38564. "module_not_derived": "00000000000000000000000000000001",
  38565. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38566. },
  38567. "port_directions": {
  38568. "I0": "input",
  38569. "I1": "input",
  38570. "I2": "input",
  38571. "I3": "input",
  38572. "O": "output"
  38573. },
  38574. "connections": {
  38575. "I0": [ 913 ],
  38576. "I1": [ 734 ],
  38577. "I2": [ 842 ],
  38578. "I3": [ 849 ],
  38579. "O": [ 1604 ]
  38580. }
  38581. },
  38582. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_DFFR_D": {
  38583. "hide_name": 0,
  38584. "type": "SB_DFFR",
  38585. "parameters": {
  38586. },
  38587. "attributes": {
  38588. "module_not_derived": "00000000000000000000000000000001",
  38589. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:264.3-300.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  38590. },
  38591. "port_directions": {
  38592. "C": "input",
  38593. "D": "input",
  38594. "Q": "output",
  38595. "R": "input"
  38596. },
  38597. "connections": {
  38598. "C": [ 42 ],
  38599. "D": [ 1605 ],
  38600. "Q": [ 841 ],
  38601. "R": [ 127 ]
  38602. }
  38603. },
  38604. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_DFFR_D": {
  38605. "hide_name": 0,
  38606. "type": "SB_DFFR",
  38607. "parameters": {
  38608. },
  38609. "attributes": {
  38610. "module_not_derived": "00000000000000000000000000000001",
  38611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:264.3-300.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  38612. },
  38613. "port_directions": {
  38614. "C": "input",
  38615. "D": "input",
  38616. "Q": "output",
  38617. "R": "input"
  38618. },
  38619. "connections": {
  38620. "C": [ 42 ],
  38621. "D": [ 1603 ],
  38622. "Q": [ 842 ],
  38623. "R": [ 127 ]
  38624. }
  38625. },
  38626. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_O": {
  38627. "hide_name": 0,
  38628. "type": "SB_LUT4",
  38629. "parameters": {
  38630. "LUT_INIT": "1000000000000000"
  38631. },
  38632. "attributes": {
  38633. "module_not_derived": "00000000000000000000000000000001",
  38634. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  38635. },
  38636. "port_directions": {
  38637. "I0": "input",
  38638. "I1": "input",
  38639. "I2": "input",
  38640. "I3": "input",
  38641. "O": "output"
  38642. },
  38643. "connections": {
  38644. "I0": [ 1580 ],
  38645. "I1": [ 1583 ],
  38646. "I2": [ 1582 ],
  38647. "I3": [ 843 ],
  38648. "O": [ 1602 ]
  38649. }
  38650. },
  38651. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0": {
  38652. "hide_name": 0,
  38653. "type": "SB_RAM40_4K",
  38654. "parameters": {
  38655. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38656. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38657. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38658. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38659. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38660. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38661. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38662. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38663. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38664. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38665. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38666. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38667. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38668. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38669. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38670. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  38671. "READ_MODE": "01",
  38672. "WRITE_MODE": "01"
  38673. },
  38674. "attributes": {
  38675. "module_not_derived": "00000000000000000000000000000001",
  38676. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  38677. },
  38678. "port_directions": {
  38679. "MASK": "input",
  38680. "RADDR": "input",
  38681. "RCLK": "input",
  38682. "RCLKE": "input",
  38683. "RDATA": "output",
  38684. "RE": "input",
  38685. "WADDR": "input",
  38686. "WCLK": "input",
  38687. "WCLKE": "input",
  38688. "WDATA": "input",
  38689. "WE": "input"
  38690. },
  38691. "connections": {
  38692. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  38693. "RADDR": [ 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1439, "0", "0" ],
  38694. "RCLK": [ 42 ],
  38695. "RCLKE": [ 1472 ],
  38696. "RDATA": [ 1332, 1606, 1326, 1607, 1260, 1608, 1338, 1609, 1256, 1610, 1335, 1611, 1293, 1612, 1341, 1613 ],
  38697. "RE": [ "1" ],
  38698. "WADDR": [ 1614, 1615, 1616, 1617, 1618, 1619, 1620, 1621, 1586, "0", "0" ],
  38699. "WCLK": [ 42 ],
  38700. "WCLKE": [ 844 ],
  38701. "WDATA": [ 1622, "0", 1623, "0", 1624, "0", 1625, "0", 1626, "0", 1627, "0", 1628, "0", 1629, "0" ],
  38702. "WE": [ "1" ]
  38703. }
  38704. },
  38705. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_1_SB_DFFE_Q": {
  38706. "hide_name": 0,
  38707. "type": "SB_DFFE",
  38708. "parameters": {
  38709. },
  38710. "attributes": {
  38711. "module_not_derived": "00000000000000000000000000000001",
  38712. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38713. },
  38714. "port_directions": {
  38715. "C": "input",
  38716. "D": "input",
  38717. "E": "input",
  38718. "Q": "output"
  38719. },
  38720. "connections": {
  38721. "C": [ 42 ],
  38722. "D": [ 1628 ],
  38723. "E": [ 1472 ],
  38724. "Q": [ 1294 ]
  38725. }
  38726. },
  38727. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_2_SB_DFFE_Q": {
  38728. "hide_name": 0,
  38729. "type": "SB_DFFE",
  38730. "parameters": {
  38731. },
  38732. "attributes": {
  38733. "module_not_derived": "00000000000000000000000000000001",
  38734. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38735. },
  38736. "port_directions": {
  38737. "C": "input",
  38738. "D": "input",
  38739. "E": "input",
  38740. "Q": "output"
  38741. },
  38742. "connections": {
  38743. "C": [ 42 ],
  38744. "D": [ 1627 ],
  38745. "E": [ 1472 ],
  38746. "Q": [ 1336 ]
  38747. }
  38748. },
  38749. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_3_SB_DFFE_Q": {
  38750. "hide_name": 0,
  38751. "type": "SB_DFFE",
  38752. "parameters": {
  38753. },
  38754. "attributes": {
  38755. "module_not_derived": "00000000000000000000000000000001",
  38756. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38757. },
  38758. "port_directions": {
  38759. "C": "input",
  38760. "D": "input",
  38761. "E": "input",
  38762. "Q": "output"
  38763. },
  38764. "connections": {
  38765. "C": [ 42 ],
  38766. "D": [ 1626 ],
  38767. "E": [ 1472 ],
  38768. "Q": [ 1257 ]
  38769. }
  38770. },
  38771. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_4_SB_DFFE_Q": {
  38772. "hide_name": 0,
  38773. "type": "SB_DFFE",
  38774. "parameters": {
  38775. },
  38776. "attributes": {
  38777. "module_not_derived": "00000000000000000000000000000001",
  38778. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38779. },
  38780. "port_directions": {
  38781. "C": "input",
  38782. "D": "input",
  38783. "E": "input",
  38784. "Q": "output"
  38785. },
  38786. "connections": {
  38787. "C": [ 42 ],
  38788. "D": [ 1625 ],
  38789. "E": [ 1472 ],
  38790. "Q": [ 1339 ]
  38791. }
  38792. },
  38793. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_5_SB_DFFE_Q": {
  38794. "hide_name": 0,
  38795. "type": "SB_DFFE",
  38796. "parameters": {
  38797. },
  38798. "attributes": {
  38799. "module_not_derived": "00000000000000000000000000000001",
  38800. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38801. },
  38802. "port_directions": {
  38803. "C": "input",
  38804. "D": "input",
  38805. "E": "input",
  38806. "Q": "output"
  38807. },
  38808. "connections": {
  38809. "C": [ 42 ],
  38810. "D": [ 1624 ],
  38811. "E": [ 1472 ],
  38812. "Q": [ 1261 ]
  38813. }
  38814. },
  38815. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_6_SB_DFFE_Q": {
  38816. "hide_name": 0,
  38817. "type": "SB_DFFE",
  38818. "parameters": {
  38819. },
  38820. "attributes": {
  38821. "module_not_derived": "00000000000000000000000000000001",
  38822. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38823. },
  38824. "port_directions": {
  38825. "C": "input",
  38826. "D": "input",
  38827. "E": "input",
  38828. "Q": "output"
  38829. },
  38830. "connections": {
  38831. "C": [ 42 ],
  38832. "D": [ 1623 ],
  38833. "E": [ 1472 ],
  38834. "Q": [ 1327 ]
  38835. }
  38836. },
  38837. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_8_SB_DFFE_Q": {
  38838. "hide_name": 0,
  38839. "type": "SB_DFFE",
  38840. "parameters": {
  38841. },
  38842. "attributes": {
  38843. "module_not_derived": "00000000000000000000000000000001",
  38844. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38845. },
  38846. "port_directions": {
  38847. "C": "input",
  38848. "D": "input",
  38849. "E": "input",
  38850. "Q": "output"
  38851. },
  38852. "connections": {
  38853. "C": [ 42 ],
  38854. "D": [ 1622 ],
  38855. "E": [ 1472 ],
  38856. "Q": [ 1333 ]
  38857. }
  38858. },
  38859. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_SB_DFFE_Q": {
  38860. "hide_name": 0,
  38861. "type": "SB_DFFE",
  38862. "parameters": {
  38863. },
  38864. "attributes": {
  38865. "module_not_derived": "00000000000000000000000000000001",
  38866. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  38867. },
  38868. "port_directions": {
  38869. "C": "input",
  38870. "D": "input",
  38871. "E": "input",
  38872. "Q": "output"
  38873. },
  38874. "connections": {
  38875. "C": [ 42 ],
  38876. "D": [ 1629 ],
  38877. "E": [ 1472 ],
  38878. "Q": [ 1342 ]
  38879. }
  38880. },
  38881. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_1_SB_DFF_Q": {
  38882. "hide_name": 0,
  38883. "type": "SB_DFF",
  38884. "parameters": {
  38885. },
  38886. "attributes": {
  38887. "module_not_derived": "00000000000000000000000000000001",
  38888. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  38889. },
  38890. "port_directions": {
  38891. "C": "input",
  38892. "D": "input",
  38893. "Q": "output"
  38894. },
  38895. "connections": {
  38896. "C": [ 42 ],
  38897. "D": [ 694 ],
  38898. "Q": [ 1619 ]
  38899. }
  38900. },
  38901. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_1_SB_DFF_Q_1": {
  38902. "hide_name": 0,
  38903. "type": "SB_DFF",
  38904. "parameters": {
  38905. },
  38906. "attributes": {
  38907. "module_not_derived": "00000000000000000000000000000001",
  38908. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  38909. },
  38910. "port_directions": {
  38911. "C": "input",
  38912. "D": "input",
  38913. "Q": "output"
  38914. },
  38915. "connections": {
  38916. "C": [ 42 ],
  38917. "D": [ 1580 ],
  38918. "Q": [ 1615 ]
  38919. }
  38920. },
  38921. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_2_SB_DFF_Q": {
  38922. "hide_name": 0,
  38923. "type": "SB_DFF",
  38924. "parameters": {
  38925. },
  38926. "attributes": {
  38927. "module_not_derived": "00000000000000000000000000000001",
  38928. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  38929. },
  38930. "port_directions": {
  38931. "C": "input",
  38932. "D": "input",
  38933. "Q": "output"
  38934. },
  38935. "connections": {
  38936. "C": [ 42 ],
  38937. "D": [ 698 ],
  38938. "Q": [ 1617 ]
  38939. }
  38940. },
  38941. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_2_SB_LUT4_O": {
  38942. "hide_name": 0,
  38943. "type": "SB_LUT4",
  38944. "parameters": {
  38945. "LUT_INIT": "0000000011110000"
  38946. },
  38947. "attributes": {
  38948. "module_not_derived": "00000000000000000000000000000001",
  38949. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  38950. },
  38951. "port_directions": {
  38952. "I0": "input",
  38953. "I1": "input",
  38954. "I2": "input",
  38955. "I3": "input",
  38956. "O": "output"
  38957. },
  38958. "connections": {
  38959. "I0": [ "0" ],
  38960. "I1": [ "0" ],
  38961. "I2": [ 1586 ],
  38962. "I3": [ 1439 ],
  38963. "O": [ 1630 ]
  38964. }
  38965. },
  38966. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_3_SB_DFF_Q": {
  38967. "hide_name": 0,
  38968. "type": "SB_DFF",
  38969. "parameters": {
  38970. },
  38971. "attributes": {
  38972. "module_not_derived": "00000000000000000000000000000001",
  38973. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  38974. },
  38975. "port_directions": {
  38976. "C": "input",
  38977. "D": "input",
  38978. "Q": "output"
  38979. },
  38980. "connections": {
  38981. "C": [ 42 ],
  38982. "D": [ 717 ],
  38983. "Q": [ 1621 ]
  38984. }
  38985. },
  38986. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_3_SB_DFF_Q_1": {
  38987. "hide_name": 0,
  38988. "type": "SB_DFF",
  38989. "parameters": {
  38990. },
  38991. "attributes": {
  38992. "module_not_derived": "00000000000000000000000000000001",
  38993. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  38994. },
  38995. "port_directions": {
  38996. "C": "input",
  38997. "D": "input",
  38998. "Q": "output"
  38999. },
  39000. "connections": {
  39001. "C": [ 42 ],
  39002. "D": [ 1582 ],
  39003. "Q": [ 1614 ]
  39004. }
  39005. },
  39006. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_4_SB_DFF_Q": {
  39007. "hide_name": 0,
  39008. "type": "SB_DFF",
  39009. "parameters": {
  39010. },
  39011. "attributes": {
  39012. "module_not_derived": "00000000000000000000000000000001",
  39013. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39014. },
  39015. "port_directions": {
  39016. "C": "input",
  39017. "D": "input",
  39018. "Q": "output"
  39019. },
  39020. "connections": {
  39021. "C": [ 42 ],
  39022. "D": [ 692 ],
  39023. "Q": [ 1620 ]
  39024. }
  39025. },
  39026. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_SB_DFF_Q": {
  39027. "hide_name": 0,
  39028. "type": "SB_DFF",
  39029. "parameters": {
  39030. },
  39031. "attributes": {
  39032. "module_not_derived": "00000000000000000000000000000001",
  39033. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39034. },
  39035. "port_directions": {
  39036. "C": "input",
  39037. "D": "input",
  39038. "Q": "output"
  39039. },
  39040. "connections": {
  39041. "C": [ 42 ],
  39042. "D": [ 696 ],
  39043. "Q": [ 1618 ]
  39044. }
  39045. },
  39046. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_SB_DFF_Q_1": {
  39047. "hide_name": 0,
  39048. "type": "SB_DFF",
  39049. "parameters": {
  39050. },
  39051. "attributes": {
  39052. "module_not_derived": "00000000000000000000000000000001",
  39053. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39054. },
  39055. "port_directions": {
  39056. "C": "input",
  39057. "D": "input",
  39058. "Q": "output"
  39059. },
  39060. "connections": {
  39061. "C": [ 42 ],
  39062. "D": [ 700 ],
  39063. "Q": [ 1616 ]
  39064. }
  39065. },
  39066. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1": {
  39067. "hide_name": 0,
  39068. "type": "SB_LUT4",
  39069. "parameters": {
  39070. "LUT_INIT": "0000000010000100"
  39071. },
  39072. "attributes": {
  39073. "module_not_derived": "00000000000000000000000000000001",
  39074. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  39075. },
  39076. "port_directions": {
  39077. "I0": "input",
  39078. "I1": "input",
  39079. "I2": "input",
  39080. "I3": "input",
  39081. "O": "output"
  39082. },
  39083. "connections": {
  39084. "I0": [ 1617 ],
  39085. "I1": [ 844 ],
  39086. "I2": [ 1410 ],
  39087. "I3": [ 1630 ],
  39088. "O": [ 1631 ]
  39089. }
  39090. },
  39091. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O_SB_LUT4_O": {
  39092. "hide_name": 0,
  39093. "type": "SB_LUT4",
  39094. "parameters": {
  39095. "LUT_INIT": "1000001001000001"
  39096. },
  39097. "attributes": {
  39098. "module_not_derived": "00000000000000000000000000000001",
  39099. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  39100. },
  39101. "port_directions": {
  39102. "I0": "input",
  39103. "I1": "input",
  39104. "I2": "input",
  39105. "I3": "input",
  39106. "O": "output"
  39107. },
  39108. "connections": {
  39109. "I0": [ 1618 ],
  39110. "I1": [ 1616 ],
  39111. "I2": [ 1419 ],
  39112. "I3": [ 1400 ],
  39113. "O": [ 1632 ]
  39114. }
  39115. },
  39116. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O_SB_LUT4_O_1": {
  39117. "hide_name": 0,
  39118. "type": "SB_LUT4",
  39119. "parameters": {
  39120. "LUT_INIT": "1000101001000101"
  39121. },
  39122. "attributes": {
  39123. "module_not_derived": "00000000000000000000000000000001",
  39124. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  39125. },
  39126. "port_directions": {
  39127. "I0": "input",
  39128. "I1": "input",
  39129. "I2": "input",
  39130. "I3": "input",
  39131. "O": "output"
  39132. },
  39133. "connections": {
  39134. "I0": [ 1620 ],
  39135. "I1": [ 1586 ],
  39136. "I2": [ 1439 ],
  39137. "I3": [ 1372 ],
  39138. "O": [ 1633 ]
  39139. }
  39140. },
  39141. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O_SB_LUT4_O_2": {
  39142. "hide_name": 0,
  39143. "type": "SB_LUT4",
  39144. "parameters": {
  39145. "LUT_INIT": "1111000000000000"
  39146. },
  39147. "attributes": {
  39148. "module_not_derived": "00000000000000000000000000000001",
  39149. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  39150. },
  39151. "port_directions": {
  39152. "I0": "input",
  39153. "I1": "input",
  39154. "I2": "input",
  39155. "I3": "input",
  39156. "O": "output"
  39157. },
  39158. "connections": {
  39159. "I0": [ "0" ],
  39160. "I1": [ "0" ],
  39161. "I2": [ 1634 ],
  39162. "I3": [ 1635 ],
  39163. "O": [ 1636 ]
  39164. }
  39165. },
  39166. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O_SB_LUT4_O_2_I2_SB_LUT4_O": {
  39167. "hide_name": 0,
  39168. "type": "SB_LUT4",
  39169. "parameters": {
  39170. "LUT_INIT": "1000001001000001"
  39171. },
  39172. "attributes": {
  39173. "module_not_derived": "00000000000000000000000000000001",
  39174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  39175. },
  39176. "port_directions": {
  39177. "I0": "input",
  39178. "I1": "input",
  39179. "I2": "input",
  39180. "I3": "input",
  39181. "O": "output"
  39182. },
  39183. "connections": {
  39184. "I0": [ 1619 ],
  39185. "I1": [ 1615 ],
  39186. "I2": [ 1443 ],
  39187. "I3": [ 1387 ],
  39188. "O": [ 1634 ]
  39189. }
  39190. },
  39191. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O_SB_LUT4_O_2_I2_SB_LUT4_O_1": {
  39192. "hide_name": 0,
  39193. "type": "SB_LUT4",
  39194. "parameters": {
  39195. "LUT_INIT": "1000010000100001"
  39196. },
  39197. "attributes": {
  39198. "module_not_derived": "00000000000000000000000000000001",
  39199. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  39200. },
  39201. "port_directions": {
  39202. "I0": "input",
  39203. "I1": "input",
  39204. "I2": "input",
  39205. "I3": "input",
  39206. "O": "output"
  39207. },
  39208. "connections": {
  39209. "I0": [ 1621 ],
  39210. "I1": [ 1614 ],
  39211. "I2": [ 1369 ],
  39212. "I3": [ 1453 ],
  39213. "O": [ 1635 ]
  39214. }
  39215. },
  39216. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_1_SB_DFF_Q": {
  39217. "hide_name": 0,
  39218. "type": "SB_DFF",
  39219. "parameters": {
  39220. },
  39221. "attributes": {
  39222. "module_not_derived": "00000000000000000000000000000001",
  39223. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39224. },
  39225. "port_directions": {
  39226. "C": "input",
  39227. "D": "input",
  39228. "Q": "output"
  39229. },
  39230. "connections": {
  39231. "C": [ 42 ],
  39232. "D": [ 815 ],
  39233. "Q": [ 1625 ]
  39234. }
  39235. },
  39236. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_2_SB_DFF_Q": {
  39237. "hide_name": 0,
  39238. "type": "SB_DFF",
  39239. "parameters": {
  39240. },
  39241. "attributes": {
  39242. "module_not_derived": "00000000000000000000000000000001",
  39243. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39244. },
  39245. "port_directions": {
  39246. "C": "input",
  39247. "D": "input",
  39248. "Q": "output"
  39249. },
  39250. "connections": {
  39251. "C": [ 42 ],
  39252. "D": [ 824 ],
  39253. "Q": [ 1627 ]
  39254. }
  39255. },
  39256. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_3_SB_DFF_Q": {
  39257. "hide_name": 0,
  39258. "type": "SB_DFF",
  39259. "parameters": {
  39260. },
  39261. "attributes": {
  39262. "module_not_derived": "00000000000000000000000000000001",
  39263. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39264. },
  39265. "port_directions": {
  39266. "C": "input",
  39267. "D": "input",
  39268. "Q": "output"
  39269. },
  39270. "connections": {
  39271. "C": [ 42 ],
  39272. "D": [ 827 ],
  39273. "Q": [ 1623 ]
  39274. }
  39275. },
  39276. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_4_SB_DFF_Q": {
  39277. "hide_name": 0,
  39278. "type": "SB_DFF",
  39279. "parameters": {
  39280. },
  39281. "attributes": {
  39282. "module_not_derived": "00000000000000000000000000000001",
  39283. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39284. },
  39285. "port_directions": {
  39286. "C": "input",
  39287. "D": "input",
  39288. "Q": "output"
  39289. },
  39290. "connections": {
  39291. "C": [ 42 ],
  39292. "D": [ 830 ],
  39293. "Q": [ 1628 ]
  39294. }
  39295. },
  39296. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_5_SB_DFF_Q": {
  39297. "hide_name": 0,
  39298. "type": "SB_DFF",
  39299. "parameters": {
  39300. },
  39301. "attributes": {
  39302. "module_not_derived": "00000000000000000000000000000001",
  39303. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39304. },
  39305. "port_directions": {
  39306. "C": "input",
  39307. "D": "input",
  39308. "Q": "output"
  39309. },
  39310. "connections": {
  39311. "C": [ 42 ],
  39312. "D": [ 839 ],
  39313. "Q": [ 1624 ]
  39314. }
  39315. },
  39316. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_6_SB_DFF_Q": {
  39317. "hide_name": 0,
  39318. "type": "SB_DFF",
  39319. "parameters": {
  39320. },
  39321. "attributes": {
  39322. "module_not_derived": "00000000000000000000000000000001",
  39323. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39324. },
  39325. "port_directions": {
  39326. "C": "input",
  39327. "D": "input",
  39328. "Q": "output"
  39329. },
  39330. "connections": {
  39331. "C": [ 42 ],
  39332. "D": [ 785 ],
  39333. "Q": [ 1626 ]
  39334. }
  39335. },
  39336. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_7_SB_DFF_Q": {
  39337. "hide_name": 0,
  39338. "type": "SB_DFF",
  39339. "parameters": {
  39340. },
  39341. "attributes": {
  39342. "module_not_derived": "00000000000000000000000000000001",
  39343. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39344. },
  39345. "port_directions": {
  39346. "C": "input",
  39347. "D": "input",
  39348. "Q": "output"
  39349. },
  39350. "connections": {
  39351. "C": [ 42 ],
  39352. "D": [ 821 ],
  39353. "Q": [ 1622 ]
  39354. }
  39355. },
  39356. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_SB_DFF_Q": {
  39357. "hide_name": 0,
  39358. "type": "SB_DFF",
  39359. "parameters": {
  39360. },
  39361. "attributes": {
  39362. "module_not_derived": "00000000000000000000000000000001",
  39363. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39364. },
  39365. "port_directions": {
  39366. "C": "input",
  39367. "D": "input",
  39368. "Q": "output"
  39369. },
  39370. "connections": {
  39371. "C": [ 42 ],
  39372. "D": [ 782 ],
  39373. "Q": [ 1629 ]
  39374. }
  39375. },
  39376. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1": {
  39377. "hide_name": 0,
  39378. "type": "SB_RAM40_4K",
  39379. "parameters": {
  39380. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39381. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39382. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39383. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39384. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39385. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39386. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39387. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39388. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39389. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39390. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39391. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39392. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39393. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39394. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39395. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39396. "READ_MODE": "01",
  39397. "WRITE_MODE": "01"
  39398. },
  39399. "attributes": {
  39400. "module_not_derived": "00000000000000000000000000000001",
  39401. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  39402. },
  39403. "port_directions": {
  39404. "MASK": "input",
  39405. "RADDR": "input",
  39406. "RCLK": "input",
  39407. "RCLKE": "input",
  39408. "RDATA": "output",
  39409. "RE": "input",
  39410. "WADDR": "input",
  39411. "WCLK": "input",
  39412. "WCLKE": "input",
  39413. "WDATA": "input",
  39414. "WE": "input"
  39415. },
  39416. "connections": {
  39417. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  39418. "RADDR": [ 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1439, "0", "0" ],
  39419. "RCLK": [ 42 ],
  39420. "RCLKE": [ 1472 ],
  39421. "RDATA": [ 1344, 1637, 1266, 1638, 1350, 1639, 1272, 1640, 1347, 1641, 1269, 1642, 1263, 1643, 1329, 1644 ],
  39422. "RE": [ "1" ],
  39423. "WADDR": [ 1614, 1615, 1616, 1617, 1618, 1619, 1620, 1621, 1586, "0", "0" ],
  39424. "WCLK": [ 42 ],
  39425. "WCLKE": [ 844 ],
  39426. "WDATA": [ 1645, "0", 1646, "0", 1647, "0", 1648, "0", 1649, "0", 1650, "0", 1651, "0", 1652, "0" ],
  39427. "WE": [ "1" ]
  39428. }
  39429. },
  39430. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_1_SB_DFFE_Q": {
  39431. "hide_name": 0,
  39432. "type": "SB_DFFE",
  39433. "parameters": {
  39434. },
  39435. "attributes": {
  39436. "module_not_derived": "00000000000000000000000000000001",
  39437. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39438. },
  39439. "port_directions": {
  39440. "C": "input",
  39441. "D": "input",
  39442. "E": "input",
  39443. "Q": "output"
  39444. },
  39445. "connections": {
  39446. "C": [ 42 ],
  39447. "D": [ 1651 ],
  39448. "E": [ 1472 ],
  39449. "Q": [ 1264 ]
  39450. }
  39451. },
  39452. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_2_SB_DFFE_Q": {
  39453. "hide_name": 0,
  39454. "type": "SB_DFFE",
  39455. "parameters": {
  39456. },
  39457. "attributes": {
  39458. "module_not_derived": "00000000000000000000000000000001",
  39459. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39460. },
  39461. "port_directions": {
  39462. "C": "input",
  39463. "D": "input",
  39464. "E": "input",
  39465. "Q": "output"
  39466. },
  39467. "connections": {
  39468. "C": [ 42 ],
  39469. "D": [ 1650 ],
  39470. "E": [ 1472 ],
  39471. "Q": [ 1270 ]
  39472. }
  39473. },
  39474. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_3_SB_DFFE_Q": {
  39475. "hide_name": 0,
  39476. "type": "SB_DFFE",
  39477. "parameters": {
  39478. },
  39479. "attributes": {
  39480. "module_not_derived": "00000000000000000000000000000001",
  39481. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39482. },
  39483. "port_directions": {
  39484. "C": "input",
  39485. "D": "input",
  39486. "E": "input",
  39487. "Q": "output"
  39488. },
  39489. "connections": {
  39490. "C": [ 42 ],
  39491. "D": [ 1649 ],
  39492. "E": [ 1472 ],
  39493. "Q": [ 1348 ]
  39494. }
  39495. },
  39496. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_4_SB_DFFE_Q": {
  39497. "hide_name": 0,
  39498. "type": "SB_DFFE",
  39499. "parameters": {
  39500. },
  39501. "attributes": {
  39502. "module_not_derived": "00000000000000000000000000000001",
  39503. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39504. },
  39505. "port_directions": {
  39506. "C": "input",
  39507. "D": "input",
  39508. "E": "input",
  39509. "Q": "output"
  39510. },
  39511. "connections": {
  39512. "C": [ 42 ],
  39513. "D": [ 1648 ],
  39514. "E": [ 1472 ],
  39515. "Q": [ 1273 ]
  39516. }
  39517. },
  39518. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_5_SB_DFFE_Q": {
  39519. "hide_name": 0,
  39520. "type": "SB_DFFE",
  39521. "parameters": {
  39522. },
  39523. "attributes": {
  39524. "module_not_derived": "00000000000000000000000000000001",
  39525. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39526. },
  39527. "port_directions": {
  39528. "C": "input",
  39529. "D": "input",
  39530. "E": "input",
  39531. "Q": "output"
  39532. },
  39533. "connections": {
  39534. "C": [ 42 ],
  39535. "D": [ 1647 ],
  39536. "E": [ 1472 ],
  39537. "Q": [ 1351 ]
  39538. }
  39539. },
  39540. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_6_SB_DFFE_Q": {
  39541. "hide_name": 0,
  39542. "type": "SB_DFFE",
  39543. "parameters": {
  39544. },
  39545. "attributes": {
  39546. "module_not_derived": "00000000000000000000000000000001",
  39547. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39548. },
  39549. "port_directions": {
  39550. "C": "input",
  39551. "D": "input",
  39552. "E": "input",
  39553. "Q": "output"
  39554. },
  39555. "connections": {
  39556. "C": [ 42 ],
  39557. "D": [ 1646 ],
  39558. "E": [ 1472 ],
  39559. "Q": [ 1267 ]
  39560. }
  39561. },
  39562. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_8_SB_DFFE_Q": {
  39563. "hide_name": 0,
  39564. "type": "SB_DFFE",
  39565. "parameters": {
  39566. },
  39567. "attributes": {
  39568. "module_not_derived": "00000000000000000000000000000001",
  39569. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39570. },
  39571. "port_directions": {
  39572. "C": "input",
  39573. "D": "input",
  39574. "E": "input",
  39575. "Q": "output"
  39576. },
  39577. "connections": {
  39578. "C": [ 42 ],
  39579. "D": [ 1645 ],
  39580. "E": [ 1472 ],
  39581. "Q": [ 1345 ]
  39582. }
  39583. },
  39584. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_SB_DFFE_Q": {
  39585. "hide_name": 0,
  39586. "type": "SB_DFFE",
  39587. "parameters": {
  39588. },
  39589. "attributes": {
  39590. "module_not_derived": "00000000000000000000000000000001",
  39591. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39592. },
  39593. "port_directions": {
  39594. "C": "input",
  39595. "D": "input",
  39596. "E": "input",
  39597. "Q": "output"
  39598. },
  39599. "connections": {
  39600. "C": [ 42 ],
  39601. "D": [ 1652 ],
  39602. "E": [ 1472 ],
  39603. "Q": [ 1330 ]
  39604. }
  39605. },
  39606. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_SB_DFFE_Q_1": {
  39607. "hide_name": 0,
  39608. "type": "SB_DFFE",
  39609. "parameters": {
  39610. },
  39611. "attributes": {
  39612. "module_not_derived": "00000000000000000000000000000001",
  39613. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39614. },
  39615. "port_directions": {
  39616. "C": "input",
  39617. "D": "input",
  39618. "E": "input",
  39619. "Q": "output"
  39620. },
  39621. "connections": {
  39622. "C": [ 42 ],
  39623. "D": [ 1653 ],
  39624. "E": [ 1472 ],
  39625. "Q": [ 1258 ]
  39626. }
  39627. },
  39628. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_SB_DFFE_Q_1_D_SB_LUT4_O": {
  39629. "hide_name": 0,
  39630. "type": "SB_LUT4",
  39631. "parameters": {
  39632. "LUT_INIT": "1000000000000000"
  39633. },
  39634. "attributes": {
  39635. "module_not_derived": "00000000000000000000000000000001",
  39636. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  39637. },
  39638. "port_directions": {
  39639. "I0": "input",
  39640. "I1": "input",
  39641. "I2": "input",
  39642. "I3": "input",
  39643. "O": "output"
  39644. },
  39645. "connections": {
  39646. "I0": [ 1632 ],
  39647. "I1": [ 1633 ],
  39648. "I2": [ 1631 ],
  39649. "I3": [ 1636 ],
  39650. "O": [ 1653 ]
  39651. }
  39652. },
  39653. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_1_SB_DFF_Q": {
  39654. "hide_name": 0,
  39655. "type": "SB_DFF",
  39656. "parameters": {
  39657. },
  39658. "attributes": {
  39659. "module_not_derived": "00000000000000000000000000000001",
  39660. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39661. },
  39662. "port_directions": {
  39663. "C": "input",
  39664. "D": "input",
  39665. "Q": "output"
  39666. },
  39667. "connections": {
  39668. "C": [ 42 ],
  39669. "D": [ 803 ],
  39670. "Q": [ 1648 ]
  39671. }
  39672. },
  39673. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_2_SB_DFF_Q": {
  39674. "hide_name": 0,
  39675. "type": "SB_DFF",
  39676. "parameters": {
  39677. },
  39678. "attributes": {
  39679. "module_not_derived": "00000000000000000000000000000001",
  39680. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39681. },
  39682. "port_directions": {
  39683. "C": "input",
  39684. "D": "input",
  39685. "Q": "output"
  39686. },
  39687. "connections": {
  39688. "C": [ 42 ],
  39689. "D": [ 806 ],
  39690. "Q": [ 1650 ]
  39691. }
  39692. },
  39693. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_3_SB_DFF_Q": {
  39694. "hide_name": 0,
  39695. "type": "SB_DFF",
  39696. "parameters": {
  39697. },
  39698. "attributes": {
  39699. "module_not_derived": "00000000000000000000000000000001",
  39700. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39701. },
  39702. "port_directions": {
  39703. "C": "input",
  39704. "D": "input",
  39705. "Q": "output"
  39706. },
  39707. "connections": {
  39708. "C": [ 42 ],
  39709. "D": [ 809 ],
  39710. "Q": [ 1646 ]
  39711. }
  39712. },
  39713. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_4_SB_DFF_Q": {
  39714. "hide_name": 0,
  39715. "type": "SB_DFF",
  39716. "parameters": {
  39717. },
  39718. "attributes": {
  39719. "module_not_derived": "00000000000000000000000000000001",
  39720. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39721. },
  39722. "port_directions": {
  39723. "C": "input",
  39724. "D": "input",
  39725. "Q": "output"
  39726. },
  39727. "connections": {
  39728. "C": [ 42 ],
  39729. "D": [ 812 ],
  39730. "Q": [ 1651 ]
  39731. }
  39732. },
  39733. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_5_SB_DFF_Q": {
  39734. "hide_name": 0,
  39735. "type": "SB_DFF",
  39736. "parameters": {
  39737. },
  39738. "attributes": {
  39739. "module_not_derived": "00000000000000000000000000000001",
  39740. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39741. },
  39742. "port_directions": {
  39743. "C": "input",
  39744. "D": "input",
  39745. "Q": "output"
  39746. },
  39747. "connections": {
  39748. "C": [ 42 ],
  39749. "D": [ 818 ],
  39750. "Q": [ 1647 ]
  39751. }
  39752. },
  39753. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_6_SB_DFF_Q": {
  39754. "hide_name": 0,
  39755. "type": "SB_DFF",
  39756. "parameters": {
  39757. },
  39758. "attributes": {
  39759. "module_not_derived": "00000000000000000000000000000001",
  39760. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39761. },
  39762. "port_directions": {
  39763. "C": "input",
  39764. "D": "input",
  39765. "Q": "output"
  39766. },
  39767. "connections": {
  39768. "C": [ 42 ],
  39769. "D": [ 746 ],
  39770. "Q": [ 1649 ]
  39771. }
  39772. },
  39773. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_7_SB_DFF_Q": {
  39774. "hide_name": 0,
  39775. "type": "SB_DFF",
  39776. "parameters": {
  39777. },
  39778. "attributes": {
  39779. "module_not_derived": "00000000000000000000000000000001",
  39780. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39781. },
  39782. "port_directions": {
  39783. "C": "input",
  39784. "D": "input",
  39785. "Q": "output"
  39786. },
  39787. "connections": {
  39788. "C": [ 42 ],
  39789. "D": [ 749 ],
  39790. "Q": [ 1645 ]
  39791. }
  39792. },
  39793. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_SB_DFF_Q": {
  39794. "hide_name": 0,
  39795. "type": "SB_DFF",
  39796. "parameters": {
  39797. },
  39798. "attributes": {
  39799. "module_not_derived": "00000000000000000000000000000001",
  39800. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  39801. },
  39802. "port_directions": {
  39803. "C": "input",
  39804. "D": "input",
  39805. "Q": "output"
  39806. },
  39807. "connections": {
  39808. "C": [ 42 ],
  39809. "D": [ 800 ],
  39810. "Q": [ 1652 ]
  39811. }
  39812. },
  39813. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2": {
  39814. "hide_name": 0,
  39815. "type": "SB_RAM40_4K",
  39816. "parameters": {
  39817. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39818. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39819. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39820. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39821. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39822. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39823. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39824. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39825. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39826. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39827. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39828. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39829. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39830. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39831. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39832. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  39833. "READ_MODE": "01",
  39834. "WRITE_MODE": "01"
  39835. },
  39836. "attributes": {
  39837. "module_not_derived": "00000000000000000000000000000001",
  39838. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  39839. },
  39840. "port_directions": {
  39841. "MASK": "input",
  39842. "RADDR": "input",
  39843. "RCLK": "input",
  39844. "RCLKE": "input",
  39845. "RDATA": "output",
  39846. "RE": "input",
  39847. "WADDR": "input",
  39848. "WCLK": "input",
  39849. "WCLKE": "input",
  39850. "WDATA": "input",
  39851. "WE": "input"
  39852. },
  39853. "connections": {
  39854. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  39855. "RADDR": [ 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1439, "0", "0" ],
  39856. "RCLK": [ 42 ],
  39857. "RCLKE": [ 1472 ],
  39858. "RDATA": [ 1323, 1654, 1311, 1655, 1317, 1656, 1305, 1657, 1320, 1658, 1308, 1659, 1314, 1660, 1302, 1661 ],
  39859. "RE": [ "1" ],
  39860. "WADDR": [ 1614, 1615, 1616, 1617, 1618, 1619, 1620, 1621, 1586, "0", "0" ],
  39861. "WCLK": [ 42 ],
  39862. "WCLKE": [ 844 ],
  39863. "WDATA": [ 1662, "0", 1663, "0", 1664, "0", 1665, "0", 1666, "0", 1667, "0", 1668, "0", 1669, "0" ],
  39864. "WE": [ "1" ]
  39865. }
  39866. },
  39867. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_1_SB_DFFE_Q": {
  39868. "hide_name": 0,
  39869. "type": "SB_DFFE",
  39870. "parameters": {
  39871. },
  39872. "attributes": {
  39873. "module_not_derived": "00000000000000000000000000000001",
  39874. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39875. },
  39876. "port_directions": {
  39877. "C": "input",
  39878. "D": "input",
  39879. "E": "input",
  39880. "Q": "output"
  39881. },
  39882. "connections": {
  39883. "C": [ 42 ],
  39884. "D": [ 1668 ],
  39885. "E": [ 1472 ],
  39886. "Q": [ 1315 ]
  39887. }
  39888. },
  39889. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_2_SB_DFFE_Q": {
  39890. "hide_name": 0,
  39891. "type": "SB_DFFE",
  39892. "parameters": {
  39893. },
  39894. "attributes": {
  39895. "module_not_derived": "00000000000000000000000000000001",
  39896. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39897. },
  39898. "port_directions": {
  39899. "C": "input",
  39900. "D": "input",
  39901. "E": "input",
  39902. "Q": "output"
  39903. },
  39904. "connections": {
  39905. "C": [ 42 ],
  39906. "D": [ 1667 ],
  39907. "E": [ 1472 ],
  39908. "Q": [ 1309 ]
  39909. }
  39910. },
  39911. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_3_SB_DFFE_Q": {
  39912. "hide_name": 0,
  39913. "type": "SB_DFFE",
  39914. "parameters": {
  39915. },
  39916. "attributes": {
  39917. "module_not_derived": "00000000000000000000000000000001",
  39918. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39919. },
  39920. "port_directions": {
  39921. "C": "input",
  39922. "D": "input",
  39923. "E": "input",
  39924. "Q": "output"
  39925. },
  39926. "connections": {
  39927. "C": [ 42 ],
  39928. "D": [ 1666 ],
  39929. "E": [ 1472 ],
  39930. "Q": [ 1321 ]
  39931. }
  39932. },
  39933. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_4_SB_DFFE_Q": {
  39934. "hide_name": 0,
  39935. "type": "SB_DFFE",
  39936. "parameters": {
  39937. },
  39938. "attributes": {
  39939. "module_not_derived": "00000000000000000000000000000001",
  39940. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39941. },
  39942. "port_directions": {
  39943. "C": "input",
  39944. "D": "input",
  39945. "E": "input",
  39946. "Q": "output"
  39947. },
  39948. "connections": {
  39949. "C": [ 42 ],
  39950. "D": [ 1665 ],
  39951. "E": [ 1472 ],
  39952. "Q": [ 1306 ]
  39953. }
  39954. },
  39955. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_5_SB_DFFE_Q": {
  39956. "hide_name": 0,
  39957. "type": "SB_DFFE",
  39958. "parameters": {
  39959. },
  39960. "attributes": {
  39961. "module_not_derived": "00000000000000000000000000000001",
  39962. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39963. },
  39964. "port_directions": {
  39965. "C": "input",
  39966. "D": "input",
  39967. "E": "input",
  39968. "Q": "output"
  39969. },
  39970. "connections": {
  39971. "C": [ 42 ],
  39972. "D": [ 1664 ],
  39973. "E": [ 1472 ],
  39974. "Q": [ 1318 ]
  39975. }
  39976. },
  39977. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_6_SB_DFFE_Q": {
  39978. "hide_name": 0,
  39979. "type": "SB_DFFE",
  39980. "parameters": {
  39981. },
  39982. "attributes": {
  39983. "module_not_derived": "00000000000000000000000000000001",
  39984. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  39985. },
  39986. "port_directions": {
  39987. "C": "input",
  39988. "D": "input",
  39989. "E": "input",
  39990. "Q": "output"
  39991. },
  39992. "connections": {
  39993. "C": [ 42 ],
  39994. "D": [ 1663 ],
  39995. "E": [ 1472 ],
  39996. "Q": [ 1312 ]
  39997. }
  39998. },
  39999. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_8_SB_DFFE_Q": {
  40000. "hide_name": 0,
  40001. "type": "SB_DFFE",
  40002. "parameters": {
  40003. },
  40004. "attributes": {
  40005. "module_not_derived": "00000000000000000000000000000001",
  40006. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40007. },
  40008. "port_directions": {
  40009. "C": "input",
  40010. "D": "input",
  40011. "E": "input",
  40012. "Q": "output"
  40013. },
  40014. "connections": {
  40015. "C": [ 42 ],
  40016. "D": [ 1662 ],
  40017. "E": [ 1472 ],
  40018. "Q": [ 1324 ]
  40019. }
  40020. },
  40021. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_SB_DFFE_Q": {
  40022. "hide_name": 0,
  40023. "type": "SB_DFFE",
  40024. "parameters": {
  40025. },
  40026. "attributes": {
  40027. "module_not_derived": "00000000000000000000000000000001",
  40028. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40029. },
  40030. "port_directions": {
  40031. "C": "input",
  40032. "D": "input",
  40033. "E": "input",
  40034. "Q": "output"
  40035. },
  40036. "connections": {
  40037. "C": [ 42 ],
  40038. "D": [ 1669 ],
  40039. "E": [ 1472 ],
  40040. "Q": [ 1303 ]
  40041. }
  40042. },
  40043. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_1_SB_DFF_Q": {
  40044. "hide_name": 0,
  40045. "type": "SB_DFF",
  40046. "parameters": {
  40047. },
  40048. "attributes": {
  40049. "module_not_derived": "00000000000000000000000000000001",
  40050. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40051. },
  40052. "port_directions": {
  40053. "C": "input",
  40054. "D": "input",
  40055. "Q": "output"
  40056. },
  40057. "connections": {
  40058. "C": [ 42 ],
  40059. "D": [ 773 ],
  40060. "Q": [ 1665 ]
  40061. }
  40062. },
  40063. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_2_SB_DFF_Q": {
  40064. "hide_name": 0,
  40065. "type": "SB_DFF",
  40066. "parameters": {
  40067. },
  40068. "attributes": {
  40069. "module_not_derived": "00000000000000000000000000000001",
  40070. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40071. },
  40072. "port_directions": {
  40073. "C": "input",
  40074. "D": "input",
  40075. "Q": "output"
  40076. },
  40077. "connections": {
  40078. "C": [ 42 ],
  40079. "D": [ 776 ],
  40080. "Q": [ 1667 ]
  40081. }
  40082. },
  40083. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_3_SB_DFF_Q": {
  40084. "hide_name": 0,
  40085. "type": "SB_DFF",
  40086. "parameters": {
  40087. },
  40088. "attributes": {
  40089. "module_not_derived": "00000000000000000000000000000001",
  40090. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40091. },
  40092. "port_directions": {
  40093. "C": "input",
  40094. "D": "input",
  40095. "Q": "output"
  40096. },
  40097. "connections": {
  40098. "C": [ 42 ],
  40099. "D": [ 779 ],
  40100. "Q": [ 1663 ]
  40101. }
  40102. },
  40103. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_4_SB_DFF_Q": {
  40104. "hide_name": 0,
  40105. "type": "SB_DFF",
  40106. "parameters": {
  40107. },
  40108. "attributes": {
  40109. "module_not_derived": "00000000000000000000000000000001",
  40110. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40111. },
  40112. "port_directions": {
  40113. "C": "input",
  40114. "D": "input",
  40115. "Q": "output"
  40116. },
  40117. "connections": {
  40118. "C": [ 42 ],
  40119. "D": [ 788 ],
  40120. "Q": [ 1668 ]
  40121. }
  40122. },
  40123. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_5_SB_DFF_Q": {
  40124. "hide_name": 0,
  40125. "type": "SB_DFF",
  40126. "parameters": {
  40127. },
  40128. "attributes": {
  40129. "module_not_derived": "00000000000000000000000000000001",
  40130. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40131. },
  40132. "port_directions": {
  40133. "C": "input",
  40134. "D": "input",
  40135. "Q": "output"
  40136. },
  40137. "connections": {
  40138. "C": [ 42 ],
  40139. "D": [ 791 ],
  40140. "Q": [ 1664 ]
  40141. }
  40142. },
  40143. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_6_SB_DFF_Q": {
  40144. "hide_name": 0,
  40145. "type": "SB_DFF",
  40146. "parameters": {
  40147. },
  40148. "attributes": {
  40149. "module_not_derived": "00000000000000000000000000000001",
  40150. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40151. },
  40152. "port_directions": {
  40153. "C": "input",
  40154. "D": "input",
  40155. "Q": "output"
  40156. },
  40157. "connections": {
  40158. "C": [ 42 ],
  40159. "D": [ 794 ],
  40160. "Q": [ 1666 ]
  40161. }
  40162. },
  40163. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_7_SB_DFF_Q": {
  40164. "hide_name": 0,
  40165. "type": "SB_DFF",
  40166. "parameters": {
  40167. },
  40168. "attributes": {
  40169. "module_not_derived": "00000000000000000000000000000001",
  40170. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40171. },
  40172. "port_directions": {
  40173. "C": "input",
  40174. "D": "input",
  40175. "Q": "output"
  40176. },
  40177. "connections": {
  40178. "C": [ 42 ],
  40179. "D": [ 797 ],
  40180. "Q": [ 1662 ]
  40181. }
  40182. },
  40183. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_SB_DFF_Q": {
  40184. "hide_name": 0,
  40185. "type": "SB_DFF",
  40186. "parameters": {
  40187. },
  40188. "attributes": {
  40189. "module_not_derived": "00000000000000000000000000000001",
  40190. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40191. },
  40192. "port_directions": {
  40193. "C": "input",
  40194. "D": "input",
  40195. "Q": "output"
  40196. },
  40197. "connections": {
  40198. "C": [ 42 ],
  40199. "D": [ 770 ],
  40200. "Q": [ 1669 ]
  40201. }
  40202. },
  40203. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3": {
  40204. "hide_name": 0,
  40205. "type": "SB_RAM40_4K",
  40206. "parameters": {
  40207. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40208. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40209. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40210. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40211. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40212. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40213. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40214. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40215. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40216. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40217. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40218. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40219. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40220. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40221. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40222. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40223. "READ_MODE": "01",
  40224. "WRITE_MODE": "01"
  40225. },
  40226. "attributes": {
  40227. "module_not_derived": "00000000000000000000000000000001",
  40228. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  40229. },
  40230. "port_directions": {
  40231. "MASK": "input",
  40232. "RADDR": "input",
  40233. "RCLK": "input",
  40234. "RCLKE": "input",
  40235. "RDATA": "output",
  40236. "RE": "input",
  40237. "WADDR": "input",
  40238. "WCLK": "input",
  40239. "WCLKE": "input",
  40240. "WDATA": "input",
  40241. "WE": "input"
  40242. },
  40243. "connections": {
  40244. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  40245. "RADDR": [ 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1439, "0", "0" ],
  40246. "RCLK": [ 42 ],
  40247. "RCLKE": [ 1472 ],
  40248. "RDATA": [ 1299, 1670, 1284, 1671, 1278, 1672, 1290, 1673, 1275, 1674, 1287, 1675, 1281, 1676, 1296, 1677 ],
  40249. "RE": [ "1" ],
  40250. "WADDR": [ 1614, 1615, 1616, 1617, 1618, 1619, 1620, 1621, 1586, "0", "0" ],
  40251. "WCLK": [ 42 ],
  40252. "WCLKE": [ 844 ],
  40253. "WDATA": [ 1678, "0", 1679, "0", 1680, "0", 1681, "0", 1682, "0", 1683, "0", 1684, "0", 1685, "0" ],
  40254. "WE": [ "1" ]
  40255. }
  40256. },
  40257. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_1_SB_DFFE_Q": {
  40258. "hide_name": 0,
  40259. "type": "SB_DFFE",
  40260. "parameters": {
  40261. },
  40262. "attributes": {
  40263. "module_not_derived": "00000000000000000000000000000001",
  40264. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40265. },
  40266. "port_directions": {
  40267. "C": "input",
  40268. "D": "input",
  40269. "E": "input",
  40270. "Q": "output"
  40271. },
  40272. "connections": {
  40273. "C": [ 42 ],
  40274. "D": [ 1684 ],
  40275. "E": [ 1472 ],
  40276. "Q": [ 1282 ]
  40277. }
  40278. },
  40279. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_2_SB_DFFE_Q": {
  40280. "hide_name": 0,
  40281. "type": "SB_DFFE",
  40282. "parameters": {
  40283. },
  40284. "attributes": {
  40285. "module_not_derived": "00000000000000000000000000000001",
  40286. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40287. },
  40288. "port_directions": {
  40289. "C": "input",
  40290. "D": "input",
  40291. "E": "input",
  40292. "Q": "output"
  40293. },
  40294. "connections": {
  40295. "C": [ 42 ],
  40296. "D": [ 1683 ],
  40297. "E": [ 1472 ],
  40298. "Q": [ 1288 ]
  40299. }
  40300. },
  40301. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_3_SB_DFFE_Q": {
  40302. "hide_name": 0,
  40303. "type": "SB_DFFE",
  40304. "parameters": {
  40305. },
  40306. "attributes": {
  40307. "module_not_derived": "00000000000000000000000000000001",
  40308. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40309. },
  40310. "port_directions": {
  40311. "C": "input",
  40312. "D": "input",
  40313. "E": "input",
  40314. "Q": "output"
  40315. },
  40316. "connections": {
  40317. "C": [ 42 ],
  40318. "D": [ 1682 ],
  40319. "E": [ 1472 ],
  40320. "Q": [ 1276 ]
  40321. }
  40322. },
  40323. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_4_SB_DFFE_Q": {
  40324. "hide_name": 0,
  40325. "type": "SB_DFFE",
  40326. "parameters": {
  40327. },
  40328. "attributes": {
  40329. "module_not_derived": "00000000000000000000000000000001",
  40330. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40331. },
  40332. "port_directions": {
  40333. "C": "input",
  40334. "D": "input",
  40335. "E": "input",
  40336. "Q": "output"
  40337. },
  40338. "connections": {
  40339. "C": [ 42 ],
  40340. "D": [ 1681 ],
  40341. "E": [ 1472 ],
  40342. "Q": [ 1291 ]
  40343. }
  40344. },
  40345. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_5_SB_DFFE_Q": {
  40346. "hide_name": 0,
  40347. "type": "SB_DFFE",
  40348. "parameters": {
  40349. },
  40350. "attributes": {
  40351. "module_not_derived": "00000000000000000000000000000001",
  40352. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40353. },
  40354. "port_directions": {
  40355. "C": "input",
  40356. "D": "input",
  40357. "E": "input",
  40358. "Q": "output"
  40359. },
  40360. "connections": {
  40361. "C": [ 42 ],
  40362. "D": [ 1680 ],
  40363. "E": [ 1472 ],
  40364. "Q": [ 1279 ]
  40365. }
  40366. },
  40367. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_6_SB_DFFE_Q": {
  40368. "hide_name": 0,
  40369. "type": "SB_DFFE",
  40370. "parameters": {
  40371. },
  40372. "attributes": {
  40373. "module_not_derived": "00000000000000000000000000000001",
  40374. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40375. },
  40376. "port_directions": {
  40377. "C": "input",
  40378. "D": "input",
  40379. "E": "input",
  40380. "Q": "output"
  40381. },
  40382. "connections": {
  40383. "C": [ 42 ],
  40384. "D": [ 1679 ],
  40385. "E": [ 1472 ],
  40386. "Q": [ 1285 ]
  40387. }
  40388. },
  40389. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_8_SB_DFFE_Q": {
  40390. "hide_name": 0,
  40391. "type": "SB_DFFE",
  40392. "parameters": {
  40393. },
  40394. "attributes": {
  40395. "module_not_derived": "00000000000000000000000000000001",
  40396. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40397. },
  40398. "port_directions": {
  40399. "C": "input",
  40400. "D": "input",
  40401. "E": "input",
  40402. "Q": "output"
  40403. },
  40404. "connections": {
  40405. "C": [ 42 ],
  40406. "D": [ 1678 ],
  40407. "E": [ 1472 ],
  40408. "Q": [ 1300 ]
  40409. }
  40410. },
  40411. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_SB_DFFE_Q": {
  40412. "hide_name": 0,
  40413. "type": "SB_DFFE",
  40414. "parameters": {
  40415. },
  40416. "attributes": {
  40417. "module_not_derived": "00000000000000000000000000000001",
  40418. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40419. },
  40420. "port_directions": {
  40421. "C": "input",
  40422. "D": "input",
  40423. "E": "input",
  40424. "Q": "output"
  40425. },
  40426. "connections": {
  40427. "C": [ 42 ],
  40428. "D": [ 1685 ],
  40429. "E": [ 1472 ],
  40430. "Q": [ 1297 ]
  40431. }
  40432. },
  40433. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_1_SB_DFF_Q": {
  40434. "hide_name": 0,
  40435. "type": "SB_DFF",
  40436. "parameters": {
  40437. },
  40438. "attributes": {
  40439. "module_not_derived": "00000000000000000000000000000001",
  40440. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40441. },
  40442. "port_directions": {
  40443. "C": "input",
  40444. "D": "input",
  40445. "Q": "output"
  40446. },
  40447. "connections": {
  40448. "C": [ 42 ],
  40449. "D": [ 836 ],
  40450. "Q": [ 1681 ]
  40451. }
  40452. },
  40453. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_2_SB_DFF_Q": {
  40454. "hide_name": 0,
  40455. "type": "SB_DFF",
  40456. "parameters": {
  40457. },
  40458. "attributes": {
  40459. "module_not_derived": "00000000000000000000000000000001",
  40460. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40461. },
  40462. "port_directions": {
  40463. "C": "input",
  40464. "D": "input",
  40465. "Q": "output"
  40466. },
  40467. "connections": {
  40468. "C": [ 42 ],
  40469. "D": [ 752 ],
  40470. "Q": [ 1683 ]
  40471. }
  40472. },
  40473. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_3_SB_DFF_Q": {
  40474. "hide_name": 0,
  40475. "type": "SB_DFF",
  40476. "parameters": {
  40477. },
  40478. "attributes": {
  40479. "module_not_derived": "00000000000000000000000000000001",
  40480. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40481. },
  40482. "port_directions": {
  40483. "C": "input",
  40484. "D": "input",
  40485. "Q": "output"
  40486. },
  40487. "connections": {
  40488. "C": [ 42 ],
  40489. "D": [ 755 ],
  40490. "Q": [ 1679 ]
  40491. }
  40492. },
  40493. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_4_SB_DFF_Q": {
  40494. "hide_name": 0,
  40495. "type": "SB_DFF",
  40496. "parameters": {
  40497. },
  40498. "attributes": {
  40499. "module_not_derived": "00000000000000000000000000000001",
  40500. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40501. },
  40502. "port_directions": {
  40503. "C": "input",
  40504. "D": "input",
  40505. "Q": "output"
  40506. },
  40507. "connections": {
  40508. "C": [ 42 ],
  40509. "D": [ 758 ],
  40510. "Q": [ 1684 ]
  40511. }
  40512. },
  40513. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_5_SB_DFF_Q": {
  40514. "hide_name": 0,
  40515. "type": "SB_DFF",
  40516. "parameters": {
  40517. },
  40518. "attributes": {
  40519. "module_not_derived": "00000000000000000000000000000001",
  40520. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40521. },
  40522. "port_directions": {
  40523. "C": "input",
  40524. "D": "input",
  40525. "Q": "output"
  40526. },
  40527. "connections": {
  40528. "C": [ 42 ],
  40529. "D": [ 761 ],
  40530. "Q": [ 1680 ]
  40531. }
  40532. },
  40533. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_6_SB_DFF_Q": {
  40534. "hide_name": 0,
  40535. "type": "SB_DFF",
  40536. "parameters": {
  40537. },
  40538. "attributes": {
  40539. "module_not_derived": "00000000000000000000000000000001",
  40540. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40541. },
  40542. "port_directions": {
  40543. "C": "input",
  40544. "D": "input",
  40545. "Q": "output"
  40546. },
  40547. "connections": {
  40548. "C": [ 42 ],
  40549. "D": [ 764 ],
  40550. "Q": [ 1682 ]
  40551. }
  40552. },
  40553. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_7_SB_DFF_Q": {
  40554. "hide_name": 0,
  40555. "type": "SB_DFF",
  40556. "parameters": {
  40557. },
  40558. "attributes": {
  40559. "module_not_derived": "00000000000000000000000000000001",
  40560. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40561. },
  40562. "port_directions": {
  40563. "C": "input",
  40564. "D": "input",
  40565. "Q": "output"
  40566. },
  40567. "connections": {
  40568. "C": [ 42 ],
  40569. "D": [ 767 ],
  40570. "Q": [ 1678 ]
  40571. }
  40572. },
  40573. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_SB_DFF_Q": {
  40574. "hide_name": 0,
  40575. "type": "SB_DFF",
  40576. "parameters": {
  40577. },
  40578. "attributes": {
  40579. "module_not_derived": "00000000000000000000000000000001",
  40580. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  40581. },
  40582. "port_directions": {
  40583. "C": "input",
  40584. "D": "input",
  40585. "Q": "output"
  40586. },
  40587. "connections": {
  40588. "C": [ 42 ],
  40589. "D": [ 833 ],
  40590. "Q": [ 1685 ]
  40591. }
  40592. },
  40593. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0": {
  40594. "hide_name": 0,
  40595. "type": "SB_RAM40_4K",
  40596. "parameters": {
  40597. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40598. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40599. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40600. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40601. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40602. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40603. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40604. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40605. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40606. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40607. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40608. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40609. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40610. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40611. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40612. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  40613. "READ_MODE": "00",
  40614. "WRITE_MODE": "00"
  40615. },
  40616. "attributes": {
  40617. "module_not_derived": "00000000000000000000000000000001",
  40618. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  40619. },
  40620. "port_directions": {
  40621. "MASK": "input",
  40622. "RADDR": "input",
  40623. "RCLK": "input",
  40624. "RCLKE": "input",
  40625. "RDATA": "output",
  40626. "RE": "input",
  40627. "WADDR": "input",
  40628. "WCLK": "input",
  40629. "WCLKE": "input",
  40630. "WDATA": "input",
  40631. "WE": "input"
  40632. },
  40633. "connections": {
  40634. "MASK": [ 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601 ],
  40635. "RADDR": [ 1419, 1410, 1400, 1387, 1372, 1369, "0", "0", "0", "0", "0" ],
  40636. "RCLK": [ 42 ],
  40637. "RCLKE": [ 1472 ],
  40638. "RDATA": [ 1686, 1687, 1688, 1689, 1690, 1691, 1692, 1693, 1694, 1695, 1696, 1697, 1698, 1699, 1700, 1701 ],
  40639. "RE": [ "1" ],
  40640. "WADDR": [ 1702, 1703, 1704, 1705, 1706, 1707, "0", "0", "0", "0", "0" ],
  40641. "WCLK": [ 42 ],
  40642. "WCLKE": [ 1600 ],
  40643. "WDATA": [ 1354, 1708, 1709, 1710, 1711, 1712, 1713, 1714, "0", 1715, 1716, 1717, 1718, 1719, 1720, 1721 ],
  40644. "WE": [ "1" ]
  40645. }
  40646. },
  40647. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_10_SB_DFFE_Q": {
  40648. "hide_name": 0,
  40649. "type": "SB_DFFE",
  40650. "parameters": {
  40651. },
  40652. "attributes": {
  40653. "module_not_derived": "00000000000000000000000000000001",
  40654. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40655. },
  40656. "port_directions": {
  40657. "C": "input",
  40658. "D": "input",
  40659. "E": "input",
  40660. "Q": "output"
  40661. },
  40662. "connections": {
  40663. "C": [ 42 ],
  40664. "D": [ 1712 ],
  40665. "E": [ 1472 ],
  40666. "Q": [ 1722 ]
  40667. }
  40668. },
  40669. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_10_SB_LUT4_I0": {
  40670. "hide_name": 0,
  40671. "type": "SB_LUT4",
  40672. "parameters": {
  40673. "LUT_INIT": "0011010111001010"
  40674. },
  40675. "attributes": {
  40676. "module_not_derived": "00000000000000000000000000000001",
  40677. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  40678. },
  40679. "port_directions": {
  40680. "I0": "input",
  40681. "I1": "input",
  40682. "I2": "input",
  40683. "I3": "input",
  40684. "O": "output"
  40685. },
  40686. "connections": {
  40687. "I0": [ 1691 ],
  40688. "I1": [ 1722 ],
  40689. "I2": [ 1556 ],
  40690. "I3": [ 1490 ],
  40691. "O": [ 1723 ]
  40692. }
  40693. },
  40694. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_11_SB_DFFE_Q": {
  40695. "hide_name": 0,
  40696. "type": "SB_DFFE",
  40697. "parameters": {
  40698. },
  40699. "attributes": {
  40700. "module_not_derived": "00000000000000000000000000000001",
  40701. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40702. },
  40703. "port_directions": {
  40704. "C": "input",
  40705. "D": "input",
  40706. "E": "input",
  40707. "Q": "output"
  40708. },
  40709. "connections": {
  40710. "C": [ 42 ],
  40711. "D": [ 1711 ],
  40712. "E": [ 1472 ],
  40713. "Q": [ 1724 ]
  40714. }
  40715. },
  40716. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_11_SB_LUT4_I1": {
  40717. "hide_name": 0,
  40718. "type": "SB_LUT4",
  40719. "parameters": {
  40720. "LUT_INIT": "0000111100110011"
  40721. },
  40722. "attributes": {
  40723. "module_not_derived": "00000000000000000000000000000001",
  40724. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  40725. },
  40726. "port_directions": {
  40727. "I0": "input",
  40728. "I1": "input",
  40729. "I2": "input",
  40730. "I3": "input",
  40731. "O": "output"
  40732. },
  40733. "connections": {
  40734. "I0": [ "0" ],
  40735. "I1": [ 1690 ],
  40736. "I2": [ 1724 ],
  40737. "I3": [ 1556 ],
  40738. "O": [ 1725 ]
  40739. }
  40740. },
  40741. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_11_SB_LUT4_I1_O_SB_LUT4_I2": {
  40742. "hide_name": 0,
  40743. "type": "SB_LUT4",
  40744. "parameters": {
  40745. "LUT_INIT": "0000000011111100"
  40746. },
  40747. "attributes": {
  40748. "module_not_derived": "00000000000000000000000000000001",
  40749. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  40750. },
  40751. "port_directions": {
  40752. "I0": "input",
  40753. "I1": "input",
  40754. "I2": "input",
  40755. "I3": "input",
  40756. "O": "output"
  40757. },
  40758. "connections": {
  40759. "I0": [ "0" ],
  40760. "I1": [ 1508 ],
  40761. "I2": [ 1725 ],
  40762. "I3": [ 1726 ],
  40763. "O": [ 1727 ]
  40764. }
  40765. },
  40766. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_11_SB_LUT4_I1_O_SB_LUT4_O": {
  40767. "hide_name": 0,
  40768. "type": "SB_LUT4",
  40769. "parameters": {
  40770. "LUT_INIT": "0011010100000000"
  40771. },
  40772. "attributes": {
  40773. "module_not_derived": "00000000000000000000000000000001",
  40774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  40775. },
  40776. "port_directions": {
  40777. "I0": "input",
  40778. "I1": "input",
  40779. "I2": "input",
  40780. "I3": "input",
  40781. "O": "output"
  40782. },
  40783. "connections": {
  40784. "I0": [ 1728 ],
  40785. "I1": [ 1729 ],
  40786. "I2": [ 1556 ],
  40787. "I3": [ 1484 ],
  40788. "O": [ 1726 ]
  40789. }
  40790. },
  40791. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_12_SB_DFFE_Q": {
  40792. "hide_name": 0,
  40793. "type": "SB_DFFE",
  40794. "parameters": {
  40795. },
  40796. "attributes": {
  40797. "module_not_derived": "00000000000000000000000000000001",
  40798. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40799. },
  40800. "port_directions": {
  40801. "C": "input",
  40802. "D": "input",
  40803. "E": "input",
  40804. "Q": "output"
  40805. },
  40806. "connections": {
  40807. "C": [ 42 ],
  40808. "D": [ 1710 ],
  40809. "E": [ 1472 ],
  40810. "Q": [ 1730 ]
  40811. }
  40812. },
  40813. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_12_SB_LUT4_I0": {
  40814. "hide_name": 0,
  40815. "type": "SB_LUT4",
  40816. "parameters": {
  40817. "LUT_INIT": "0011010100000000"
  40818. },
  40819. "attributes": {
  40820. "module_not_derived": "00000000000000000000000000000001",
  40821. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  40822. },
  40823. "port_directions": {
  40824. "I0": "input",
  40825. "I1": "input",
  40826. "I2": "input",
  40827. "I3": "input",
  40828. "O": "output"
  40829. },
  40830. "connections": {
  40831. "I0": [ 1689 ],
  40832. "I1": [ 1730 ],
  40833. "I2": [ 1556 ],
  40834. "I3": [ 1486 ],
  40835. "O": [ 1731 ]
  40836. }
  40837. },
  40838. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_13_SB_DFFE_Q": {
  40839. "hide_name": 0,
  40840. "type": "SB_DFFE",
  40841. "parameters": {
  40842. },
  40843. "attributes": {
  40844. "module_not_derived": "00000000000000000000000000000001",
  40845. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40846. },
  40847. "port_directions": {
  40848. "C": "input",
  40849. "D": "input",
  40850. "E": "input",
  40851. "Q": "output"
  40852. },
  40853. "connections": {
  40854. "C": [ 42 ],
  40855. "D": [ 1709 ],
  40856. "E": [ 1472 ],
  40857. "Q": [ 1732 ]
  40858. }
  40859. },
  40860. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_13_SB_LUT4_I0": {
  40861. "hide_name": 0,
  40862. "type": "SB_LUT4",
  40863. "parameters": {
  40864. "LUT_INIT": "1100101000110101"
  40865. },
  40866. "attributes": {
  40867. "module_not_derived": "00000000000000000000000000000001",
  40868. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  40869. },
  40870. "port_directions": {
  40871. "I0": "input",
  40872. "I1": "input",
  40873. "I2": "input",
  40874. "I3": "input",
  40875. "O": "output"
  40876. },
  40877. "connections": {
  40878. "I0": [ 1688 ],
  40879. "I1": [ 1732 ],
  40880. "I2": [ 1556 ],
  40881. "I3": [ 1502 ],
  40882. "O": [ 1733 ]
  40883. }
  40884. },
  40885. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_13_SB_LUT4_I0_O_SB_LUT4_O": {
  40886. "hide_name": 0,
  40887. "type": "SB_LUT4",
  40888. "parameters": {
  40889. "LUT_INIT": "1111000000000000"
  40890. },
  40891. "attributes": {
  40892. "module_not_derived": "00000000000000000000000000000001",
  40893. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  40894. },
  40895. "port_directions": {
  40896. "I0": "input",
  40897. "I1": "input",
  40898. "I2": "input",
  40899. "I3": "input",
  40900. "O": "output"
  40901. },
  40902. "connections": {
  40903. "I0": [ "0" ],
  40904. "I1": [ "0" ],
  40905. "I2": [ 1496 ],
  40906. "I3": [ 1734 ],
  40907. "O": [ 1735 ]
  40908. }
  40909. },
  40910. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_14_SB_DFFE_Q": {
  40911. "hide_name": 0,
  40912. "type": "SB_DFFE",
  40913. "parameters": {
  40914. },
  40915. "attributes": {
  40916. "module_not_derived": "00000000000000000000000000000001",
  40917. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40918. },
  40919. "port_directions": {
  40920. "C": "input",
  40921. "D": "input",
  40922. "E": "input",
  40923. "Q": "output"
  40924. },
  40925. "connections": {
  40926. "C": [ 42 ],
  40927. "D": [ 1708 ],
  40928. "E": [ 1472 ],
  40929. "Q": [ 1736 ]
  40930. }
  40931. },
  40932. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_14_SB_LUT4_I1": {
  40933. "hide_name": 0,
  40934. "type": "SB_LUT4",
  40935. "parameters": {
  40936. "LUT_INIT": "0000111100110011"
  40937. },
  40938. "attributes": {
  40939. "module_not_derived": "00000000000000000000000000000001",
  40940. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  40941. },
  40942. "port_directions": {
  40943. "I0": "input",
  40944. "I1": "input",
  40945. "I2": "input",
  40946. "I3": "input",
  40947. "O": "output"
  40948. },
  40949. "connections": {
  40950. "I0": [ "0" ],
  40951. "I1": [ 1687 ],
  40952. "I2": [ 1736 ],
  40953. "I3": [ 1556 ],
  40954. "O": [ 1737 ]
  40955. }
  40956. },
  40957. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_15_SB_DFFE_Q": {
  40958. "hide_name": 0,
  40959. "type": "SB_DFFE",
  40960. "parameters": {
  40961. },
  40962. "attributes": {
  40963. "module_not_derived": "00000000000000000000000000000001",
  40964. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  40965. },
  40966. "port_directions": {
  40967. "C": "input",
  40968. "D": "input",
  40969. "E": "input",
  40970. "Q": "output"
  40971. },
  40972. "connections": {
  40973. "C": [ 42 ],
  40974. "D": [ 1354 ],
  40975. "E": [ 1472 ],
  40976. "Q": [ 1738 ]
  40977. }
  40978. },
  40979. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_15_SB_LUT4_O": {
  40980. "hide_name": 0,
  40981. "type": "SB_LUT4",
  40982. "parameters": {
  40983. "LUT_INIT": "0000000011001010"
  40984. },
  40985. "attributes": {
  40986. "module_not_derived": "00000000000000000000000000000001",
  40987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  40988. },
  40989. "port_directions": {
  40990. "I0": "input",
  40991. "I1": "input",
  40992. "I2": "input",
  40993. "I3": "input",
  40994. "O": "output"
  40995. },
  40996. "connections": {
  40997. "I0": [ 1689 ],
  40998. "I1": [ 1730 ],
  40999. "I2": [ 1556 ],
  41000. "I3": [ 1486 ],
  41001. "O": [ 1739 ]
  41002. }
  41003. },
  41004. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_1_SB_DFFE_Q": {
  41005. "hide_name": 0,
  41006. "type": "SB_DFFE",
  41007. "parameters": {
  41008. },
  41009. "attributes": {
  41010. "module_not_derived": "00000000000000000000000000000001",
  41011. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41012. },
  41013. "port_directions": {
  41014. "C": "input",
  41015. "D": "input",
  41016. "E": "input",
  41017. "Q": "output"
  41018. },
  41019. "connections": {
  41020. "C": [ 42 ],
  41021. "D": [ 1720 ],
  41022. "E": [ 1472 ],
  41023. "Q": [ 1740 ]
  41024. }
  41025. },
  41026. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_1_SB_LUT4_I1": {
  41027. "hide_name": 0,
  41028. "type": "SB_LUT4",
  41029. "parameters": {
  41030. "LUT_INIT": "0000111100110011"
  41031. },
  41032. "attributes": {
  41033. "module_not_derived": "00000000000000000000000000000001",
  41034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41035. },
  41036. "port_directions": {
  41037. "I0": "input",
  41038. "I1": "input",
  41039. "I2": "input",
  41040. "I3": "input",
  41041. "O": "output"
  41042. },
  41043. "connections": {
  41044. "I0": [ "0" ],
  41045. "I1": [ 1700 ],
  41046. "I2": [ 1740 ],
  41047. "I3": [ 1556 ],
  41048. "O": [ 1734 ]
  41049. }
  41050. },
  41051. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_1_SB_LUT4_I1_O_SB_LUT4_I2": {
  41052. "hide_name": 0,
  41053. "type": "SB_LUT4",
  41054. "parameters": {
  41055. "LUT_INIT": "0000000011111100"
  41056. },
  41057. "attributes": {
  41058. "module_not_derived": "00000000000000000000000000000001",
  41059. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41060. },
  41061. "port_directions": {
  41062. "I0": "input",
  41063. "I1": "input",
  41064. "I2": "input",
  41065. "I3": "input",
  41066. "O": "output"
  41067. },
  41068. "connections": {
  41069. "I0": [ "0" ],
  41070. "I1": [ 1496 ],
  41071. "I2": [ 1734 ],
  41072. "I3": [ 1741 ],
  41073. "O": [ 1742 ]
  41074. }
  41075. },
  41076. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_1_SB_LUT4_I1_O_SB_LUT4_O": {
  41077. "hide_name": 0,
  41078. "type": "SB_LUT4",
  41079. "parameters": {
  41080. "LUT_INIT": "0000000011001010"
  41081. },
  41082. "attributes": {
  41083. "module_not_derived": "00000000000000000000000000000001",
  41084. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41085. },
  41086. "port_directions": {
  41087. "I0": "input",
  41088. "I1": "input",
  41089. "I2": "input",
  41090. "I3": "input",
  41091. "O": "output"
  41092. },
  41093. "connections": {
  41094. "I0": [ 1743 ],
  41095. "I1": [ 1744 ],
  41096. "I2": [ 1556 ],
  41097. "I3": [ 1506 ],
  41098. "O": [ 1741 ]
  41099. }
  41100. },
  41101. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2_SB_DFFE_Q": {
  41102. "hide_name": 0,
  41103. "type": "SB_DFFE",
  41104. "parameters": {
  41105. },
  41106. "attributes": {
  41107. "module_not_derived": "00000000000000000000000000000001",
  41108. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41109. },
  41110. "port_directions": {
  41111. "C": "input",
  41112. "D": "input",
  41113. "E": "input",
  41114. "Q": "output"
  41115. },
  41116. "connections": {
  41117. "C": [ 42 ],
  41118. "D": [ 1719 ],
  41119. "E": [ 1472 ],
  41120. "Q": [ 1745 ]
  41121. }
  41122. },
  41123. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2_SB_LUT4_I1": {
  41124. "hide_name": 0,
  41125. "type": "SB_LUT4",
  41126. "parameters": {
  41127. "LUT_INIT": "0000111100110011"
  41128. },
  41129. "attributes": {
  41130. "module_not_derived": "00000000000000000000000000000001",
  41131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41132. },
  41133. "port_directions": {
  41134. "I0": "input",
  41135. "I1": "input",
  41136. "I2": "input",
  41137. "I3": "input",
  41138. "O": "output"
  41139. },
  41140. "connections": {
  41141. "I0": [ "0" ],
  41142. "I1": [ 1699 ],
  41143. "I2": [ 1745 ],
  41144. "I3": [ 1556 ],
  41145. "O": [ 1746 ]
  41146. }
  41147. },
  41148. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2_SB_LUT4_I1_O_SB_LUT4_I1": {
  41149. "hide_name": 0,
  41150. "type": "SB_LUT4",
  41151. "parameters": {
  41152. "LUT_INIT": "0000000000000110"
  41153. },
  41154. "attributes": {
  41155. "module_not_derived": "00000000000000000000000000000001",
  41156. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41157. },
  41158. "port_directions": {
  41159. "I0": "input",
  41160. "I1": "input",
  41161. "I2": "input",
  41162. "I3": "input",
  41163. "O": "output"
  41164. },
  41165. "connections": {
  41166. "I0": [ 1488 ],
  41167. "I1": [ 1746 ],
  41168. "I2": [ 1747 ],
  41169. "I3": [ 1748 ],
  41170. "O": [ 1749 ]
  41171. }
  41172. },
  41173. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2_SB_LUT4_I1_O_SB_LUT4_O": {
  41174. "hide_name": 0,
  41175. "type": "SB_LUT4",
  41176. "parameters": {
  41177. "LUT_INIT": "0000000011001010"
  41178. },
  41179. "attributes": {
  41180. "module_not_derived": "00000000000000000000000000000001",
  41181. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41182. },
  41183. "port_directions": {
  41184. "I0": "input",
  41185. "I1": "input",
  41186. "I2": "input",
  41187. "I3": "input",
  41188. "O": "output"
  41189. },
  41190. "connections": {
  41191. "I0": [ 1728 ],
  41192. "I1": [ 1729 ],
  41193. "I2": [ 1556 ],
  41194. "I3": [ 1484 ],
  41195. "O": [ 1747 ]
  41196. }
  41197. },
  41198. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2_SB_LUT4_I1_O_SB_LUT4_O_1": {
  41199. "hide_name": 0,
  41200. "type": "SB_LUT4",
  41201. "parameters": {
  41202. "LUT_INIT": "0011010100000000"
  41203. },
  41204. "attributes": {
  41205. "module_not_derived": "00000000000000000000000000000001",
  41206. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41207. },
  41208. "port_directions": {
  41209. "I0": "input",
  41210. "I1": "input",
  41211. "I2": "input",
  41212. "I3": "input",
  41213. "O": "output"
  41214. },
  41215. "connections": {
  41216. "I0": [ 1554 ],
  41217. "I1": [ 1555 ],
  41218. "I2": [ 1556 ],
  41219. "I3": [ 1482 ],
  41220. "O": [ 1748 ]
  41221. }
  41222. },
  41223. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3_SB_DFFE_Q": {
  41224. "hide_name": 0,
  41225. "type": "SB_DFFE",
  41226. "parameters": {
  41227. },
  41228. "attributes": {
  41229. "module_not_derived": "00000000000000000000000000000001",
  41230. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41231. },
  41232. "port_directions": {
  41233. "C": "input",
  41234. "D": "input",
  41235. "E": "input",
  41236. "Q": "output"
  41237. },
  41238. "connections": {
  41239. "C": [ 42 ],
  41240. "D": [ 1718 ],
  41241. "E": [ 1472 ],
  41242. "Q": [ 1750 ]
  41243. }
  41244. },
  41245. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3_SB_LUT4_I1": {
  41246. "hide_name": 0,
  41247. "type": "SB_LUT4",
  41248. "parameters": {
  41249. "LUT_INIT": "0000111100110011"
  41250. },
  41251. "attributes": {
  41252. "module_not_derived": "00000000000000000000000000000001",
  41253. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41254. },
  41255. "port_directions": {
  41256. "I0": "input",
  41257. "I1": "input",
  41258. "I2": "input",
  41259. "I3": "input",
  41260. "O": "output"
  41261. },
  41262. "connections": {
  41263. "I0": [ "0" ],
  41264. "I1": [ 1698 ],
  41265. "I2": [ 1750 ],
  41266. "I3": [ 1556 ],
  41267. "O": [ 1751 ]
  41268. }
  41269. },
  41270. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3_SB_LUT4_I1_O_SB_LUT4_I2": {
  41271. "hide_name": 0,
  41272. "type": "SB_LUT4",
  41273. "parameters": {
  41274. "LUT_INIT": "0001001101011111"
  41275. },
  41276. "attributes": {
  41277. "module_not_derived": "00000000000000000000000000000001",
  41278. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41279. },
  41280. "port_directions": {
  41281. "I0": "input",
  41282. "I1": "input",
  41283. "I2": "input",
  41284. "I3": "input",
  41285. "O": "output"
  41286. },
  41287. "connections": {
  41288. "I0": [ 1504 ],
  41289. "I1": [ 1508 ],
  41290. "I2": [ 1751 ],
  41291. "I3": [ 1725 ],
  41292. "O": [ 1752 ]
  41293. }
  41294. },
  41295. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  41296. "hide_name": 0,
  41297. "type": "SB_LUT4",
  41298. "parameters": {
  41299. "LUT_INIT": "0000000011111100"
  41300. },
  41301. "attributes": {
  41302. "module_not_derived": "00000000000000000000000000000001",
  41303. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41304. },
  41305. "port_directions": {
  41306. "I0": "input",
  41307. "I1": "input",
  41308. "I2": "input",
  41309. "I3": "input",
  41310. "O": "output"
  41311. },
  41312. "connections": {
  41313. "I0": [ "0" ],
  41314. "I1": [ 1504 ],
  41315. "I2": [ 1751 ],
  41316. "I3": [ 1753 ],
  41317. "O": [ 1754 ]
  41318. }
  41319. },
  41320. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3_SB_LUT4_I1_O_SB_LUT4_O": {
  41321. "hide_name": 0,
  41322. "type": "SB_LUT4",
  41323. "parameters": {
  41324. "LUT_INIT": "0011010100000000"
  41325. },
  41326. "attributes": {
  41327. "module_not_derived": "00000000000000000000000000000001",
  41328. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41329. },
  41330. "port_directions": {
  41331. "I0": "input",
  41332. "I1": "input",
  41333. "I2": "input",
  41334. "I3": "input",
  41335. "O": "output"
  41336. },
  41337. "connections": {
  41338. "I0": [ 1695 ],
  41339. "I1": [ 1755 ],
  41340. "I2": [ 1556 ],
  41341. "I3": [ 1492 ],
  41342. "O": [ 1753 ]
  41343. }
  41344. },
  41345. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_DFFE_Q": {
  41346. "hide_name": 0,
  41347. "type": "SB_DFFE",
  41348. "parameters": {
  41349. },
  41350. "attributes": {
  41351. "module_not_derived": "00000000000000000000000000000001",
  41352. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41353. },
  41354. "port_directions": {
  41355. "C": "input",
  41356. "D": "input",
  41357. "E": "input",
  41358. "Q": "output"
  41359. },
  41360. "connections": {
  41361. "C": [ 42 ],
  41362. "D": [ 1717 ],
  41363. "E": [ 1472 ],
  41364. "Q": [ 1756 ]
  41365. }
  41366. },
  41367. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1": {
  41368. "hide_name": 0,
  41369. "type": "SB_LUT4",
  41370. "parameters": {
  41371. "LUT_INIT": "0000111100110011"
  41372. },
  41373. "attributes": {
  41374. "module_not_derived": "00000000000000000000000000000001",
  41375. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41376. },
  41377. "port_directions": {
  41378. "I0": "input",
  41379. "I1": "input",
  41380. "I2": "input",
  41381. "I3": "input",
  41382. "O": "output"
  41383. },
  41384. "connections": {
  41385. "I0": [ "0" ],
  41386. "I1": [ 1697 ],
  41387. "I2": [ 1756 ],
  41388. "I3": [ 1556 ],
  41389. "O": [ 1757 ]
  41390. }
  41391. },
  41392. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I1": {
  41393. "hide_name": 0,
  41394. "type": "SB_LUT4",
  41395. "parameters": {
  41396. "LUT_INIT": "0000000000000110"
  41397. },
  41398. "attributes": {
  41399. "module_not_derived": "00000000000000000000000000000001",
  41400. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41401. },
  41402. "port_directions": {
  41403. "I0": "input",
  41404. "I1": "input",
  41405. "I2": "input",
  41406. "I3": "input",
  41407. "O": "output"
  41408. },
  41409. "connections": {
  41410. "I0": [ 1522 ],
  41411. "I1": [ 1757 ],
  41412. "I2": [ 1758 ],
  41413. "I3": [ 1759 ],
  41414. "O": [ 1760 ]
  41415. }
  41416. },
  41417. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I1_O_SB_LUT4_O": {
  41418. "hide_name": 0,
  41419. "type": "SB_LUT4",
  41420. "parameters": {
  41421. "LUT_INIT": "0001000000000000"
  41422. },
  41423. "attributes": {
  41424. "module_not_derived": "00000000000000000000000000000001",
  41425. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41426. },
  41427. "port_directions": {
  41428. "I0": "input",
  41429. "I1": "input",
  41430. "I2": "input",
  41431. "I3": "input",
  41432. "O": "output"
  41433. },
  41434. "connections": {
  41435. "I0": [ 1557 ],
  41436. "I1": [ 1761 ],
  41437. "I2": [ 1762 ],
  41438. "I3": [ 1749 ],
  41439. "O": [ 1763 ]
  41440. }
  41441. },
  41442. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_O": {
  41443. "hide_name": 0,
  41444. "type": "SB_LUT4",
  41445. "parameters": {
  41446. "LUT_INIT": "0000000011001010"
  41447. },
  41448. "attributes": {
  41449. "module_not_derived": "00000000000000000000000000000001",
  41450. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41451. },
  41452. "port_directions": {
  41453. "I0": "input",
  41454. "I1": "input",
  41455. "I2": "input",
  41456. "I3": "input",
  41457. "O": "output"
  41458. },
  41459. "connections": {
  41460. "I0": [ 1695 ],
  41461. "I1": [ 1755 ],
  41462. "I2": [ 1556 ],
  41463. "I3": [ 1492 ],
  41464. "O": [ 1758 ]
  41465. }
  41466. },
  41467. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_O_1": {
  41468. "hide_name": 0,
  41469. "type": "SB_LUT4",
  41470. "parameters": {
  41471. "LUT_INIT": "0011010100000000"
  41472. },
  41473. "attributes": {
  41474. "module_not_derived": "00000000000000000000000000000001",
  41475. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41476. },
  41477. "port_directions": {
  41478. "I0": "input",
  41479. "I1": "input",
  41480. "I2": "input",
  41481. "I3": "input",
  41482. "O": "output"
  41483. },
  41484. "connections": {
  41485. "I0": [ 1743 ],
  41486. "I1": [ 1744 ],
  41487. "I2": [ 1556 ],
  41488. "I3": [ 1506 ],
  41489. "O": [ 1759 ]
  41490. }
  41491. },
  41492. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_DFFE_Q": {
  41493. "hide_name": 0,
  41494. "type": "SB_DFFE",
  41495. "parameters": {
  41496. },
  41497. "attributes": {
  41498. "module_not_derived": "00000000000000000000000000000001",
  41499. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41500. },
  41501. "port_directions": {
  41502. "C": "input",
  41503. "D": "input",
  41504. "E": "input",
  41505. "Q": "output"
  41506. },
  41507. "connections": {
  41508. "C": [ 42 ],
  41509. "D": [ 1716 ],
  41510. "E": [ 1472 ],
  41511. "Q": [ 1764 ]
  41512. }
  41513. },
  41514. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1": {
  41515. "hide_name": 0,
  41516. "type": "SB_LUT4",
  41517. "parameters": {
  41518. "LUT_INIT": "0000111100110011"
  41519. },
  41520. "attributes": {
  41521. "module_not_derived": "00000000000000000000000000000001",
  41522. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41523. },
  41524. "port_directions": {
  41525. "I0": "input",
  41526. "I1": "input",
  41527. "I2": "input",
  41528. "I3": "input",
  41529. "O": "output"
  41530. },
  41531. "connections": {
  41532. "I0": [ "0" ],
  41533. "I1": [ 1696 ],
  41534. "I2": [ 1764 ],
  41535. "I3": [ 1556 ],
  41536. "O": [ 1765 ]
  41537. }
  41538. },
  41539. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2": {
  41540. "hide_name": 0,
  41541. "type": "SB_LUT4",
  41542. "parameters": {
  41543. "LUT_INIT": "0011110000000000"
  41544. },
  41545. "attributes": {
  41546. "module_not_derived": "00000000000000000000000000000001",
  41547. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41548. },
  41549. "port_directions": {
  41550. "I0": "input",
  41551. "I1": "input",
  41552. "I2": "input",
  41553. "I3": "input",
  41554. "O": "output"
  41555. },
  41556. "connections": {
  41557. "I0": [ "0" ],
  41558. "I1": [ 1500 ],
  41559. "I2": [ 1765 ],
  41560. "I3": [ 1766 ],
  41561. "O": [ 1767 ]
  41562. }
  41563. },
  41564. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  41565. "hide_name": 0,
  41566. "type": "SB_LUT4",
  41567. "parameters": {
  41568. "LUT_INIT": "0000000100000000"
  41569. },
  41570. "attributes": {
  41571. "module_not_derived": "00000000000000000000000000000001",
  41572. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41573. },
  41574. "port_directions": {
  41575. "I0": "input",
  41576. "I1": "input",
  41577. "I2": "input",
  41578. "I3": "input",
  41579. "O": "output"
  41580. },
  41581. "connections": {
  41582. "I0": [ 1768 ],
  41583. "I1": [ 1723 ],
  41584. "I2": [ 1769 ],
  41585. "I3": [ 1770 ],
  41586. "O": [ 1771 ]
  41587. }
  41588. },
  41589. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2_O_SB_LUT4_O_1": {
  41590. "hide_name": 0,
  41591. "type": "SB_LUT4",
  41592. "parameters": {
  41593. "LUT_INIT": "1000000000000000"
  41594. },
  41595. "attributes": {
  41596. "module_not_derived": "00000000000000000000000000000001",
  41597. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41598. },
  41599. "port_directions": {
  41600. "I0": "input",
  41601. "I1": "input",
  41602. "I2": "input",
  41603. "I3": "input",
  41604. "O": "output"
  41605. },
  41606. "connections": {
  41607. "I0": [ 1752 ],
  41608. "I1": [ 1742 ],
  41609. "I2": [ 1760 ],
  41610. "I3": [ 1763 ],
  41611. "O": [ 1772 ]
  41612. }
  41613. },
  41614. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_O": {
  41615. "hide_name": 0,
  41616. "type": "SB_LUT4",
  41617. "parameters": {
  41618. "LUT_INIT": "0001010100111111"
  41619. },
  41620. "attributes": {
  41621. "module_not_derived": "00000000000000000000000000000001",
  41622. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41623. },
  41624. "port_directions": {
  41625. "I0": "input",
  41626. "I1": "input",
  41627. "I2": "input",
  41628. "I3": "input",
  41629. "O": "output"
  41630. },
  41631. "connections": {
  41632. "I0": [ 1518 ],
  41633. "I1": [ 1520 ],
  41634. "I2": [ 1773 ],
  41635. "I3": [ 1774 ],
  41636. "O": [ 1766 ]
  41637. }
  41638. },
  41639. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_6_SB_DFFE_Q": {
  41640. "hide_name": 0,
  41641. "type": "SB_DFFE",
  41642. "parameters": {
  41643. },
  41644. "attributes": {
  41645. "module_not_derived": "00000000000000000000000000000001",
  41646. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41647. },
  41648. "port_directions": {
  41649. "C": "input",
  41650. "D": "input",
  41651. "E": "input",
  41652. "Q": "output"
  41653. },
  41654. "connections": {
  41655. "C": [ 42 ],
  41656. "D": [ 1715 ],
  41657. "E": [ 1472 ],
  41658. "Q": [ 1755 ]
  41659. }
  41660. },
  41661. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_8_SB_DFFE_Q": {
  41662. "hide_name": 0,
  41663. "type": "SB_DFFE",
  41664. "parameters": {
  41665. },
  41666. "attributes": {
  41667. "module_not_derived": "00000000000000000000000000000001",
  41668. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41669. },
  41670. "port_directions": {
  41671. "C": "input",
  41672. "D": "input",
  41673. "E": "input",
  41674. "Q": "output"
  41675. },
  41676. "connections": {
  41677. "C": [ 42 ],
  41678. "D": [ 1714 ],
  41679. "E": [ 1472 ],
  41680. "Q": [ 1775 ]
  41681. }
  41682. },
  41683. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_8_SB_LUT4_I1": {
  41684. "hide_name": 0,
  41685. "type": "SB_LUT4",
  41686. "parameters": {
  41687. "LUT_INIT": "0000111100110011"
  41688. },
  41689. "attributes": {
  41690. "module_not_derived": "00000000000000000000000000000001",
  41691. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41692. },
  41693. "port_directions": {
  41694. "I0": "input",
  41695. "I1": "input",
  41696. "I2": "input",
  41697. "I3": "input",
  41698. "O": "output"
  41699. },
  41700. "connections": {
  41701. "I0": [ "0" ],
  41702. "I1": [ 1693 ],
  41703. "I2": [ 1775 ],
  41704. "I3": [ 1556 ],
  41705. "O": [ 1773 ]
  41706. }
  41707. },
  41708. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_8_SB_LUT4_I1_O_SB_LUT4_I1": {
  41709. "hide_name": 0,
  41710. "type": "SB_LUT4",
  41711. "parameters": {
  41712. "LUT_INIT": "0000000011100000"
  41713. },
  41714. "attributes": {
  41715. "module_not_derived": "00000000000000000000000000000001",
  41716. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41717. },
  41718. "port_directions": {
  41719. "I0": "input",
  41720. "I1": "input",
  41721. "I2": "input",
  41722. "I3": "input",
  41723. "O": "output"
  41724. },
  41725. "connections": {
  41726. "I0": [ 1520 ],
  41727. "I1": [ 1773 ],
  41728. "I2": [ 1733 ],
  41729. "I3": [ 1735 ],
  41730. "O": [ 1776 ]
  41731. }
  41732. },
  41733. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_9_SB_DFFE_Q": {
  41734. "hide_name": 0,
  41735. "type": "SB_DFFE",
  41736. "parameters": {
  41737. },
  41738. "attributes": {
  41739. "module_not_derived": "00000000000000000000000000000001",
  41740. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41741. },
  41742. "port_directions": {
  41743. "C": "input",
  41744. "D": "input",
  41745. "E": "input",
  41746. "Q": "output"
  41747. },
  41748. "connections": {
  41749. "C": [ 42 ],
  41750. "D": [ 1713 ],
  41751. "E": [ 1472 ],
  41752. "Q": [ 1777 ]
  41753. }
  41754. },
  41755. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_9_SB_LUT4_I0": {
  41756. "hide_name": 0,
  41757. "type": "SB_LUT4",
  41758. "parameters": {
  41759. "LUT_INIT": "0011010111001010"
  41760. },
  41761. "attributes": {
  41762. "module_not_derived": "00000000000000000000000000000001",
  41763. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41764. },
  41765. "port_directions": {
  41766. "I0": "input",
  41767. "I1": "input",
  41768. "I2": "input",
  41769. "I3": "input",
  41770. "O": "output"
  41771. },
  41772. "connections": {
  41773. "I0": [ 1692 ],
  41774. "I1": [ 1777 ],
  41775. "I2": [ 1556 ],
  41776. "I3": [ 1498 ],
  41777. "O": [ 1769 ]
  41778. }
  41779. },
  41780. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_DFFE_Q": {
  41781. "hide_name": 0,
  41782. "type": "SB_DFFE",
  41783. "parameters": {
  41784. },
  41785. "attributes": {
  41786. "module_not_derived": "00000000000000000000000000000001",
  41787. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  41788. },
  41789. "port_directions": {
  41790. "C": "input",
  41791. "D": "input",
  41792. "E": "input",
  41793. "Q": "output"
  41794. },
  41795. "connections": {
  41796. "C": [ 42 ],
  41797. "D": [ 1721 ],
  41798. "E": [ 1472 ],
  41799. "Q": [ 1778 ]
  41800. }
  41801. },
  41802. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1": {
  41803. "hide_name": 0,
  41804. "type": "SB_LUT4",
  41805. "parameters": {
  41806. "LUT_INIT": "0000111100110011"
  41807. },
  41808. "attributes": {
  41809. "module_not_derived": "00000000000000000000000000000001",
  41810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41811. },
  41812. "port_directions": {
  41813. "I0": "input",
  41814. "I1": "input",
  41815. "I2": "input",
  41816. "I3": "input",
  41817. "O": "output"
  41818. },
  41819. "connections": {
  41820. "I0": [ "0" ],
  41821. "I1": [ 1701 ],
  41822. "I2": [ 1778 ],
  41823. "I3": [ 1556 ],
  41824. "O": [ 1774 ]
  41825. }
  41826. },
  41827. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2": {
  41828. "hide_name": 0,
  41829. "type": "SB_LUT4",
  41830. "parameters": {
  41831. "LUT_INIT": "0101010011111100"
  41832. },
  41833. "attributes": {
  41834. "module_not_derived": "00000000000000000000000000000001",
  41835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41836. },
  41837. "port_directions": {
  41838. "I0": "input",
  41839. "I1": "input",
  41840. "I2": "input",
  41841. "I3": "input",
  41842. "O": "output"
  41843. },
  41844. "connections": {
  41845. "I0": [ 1512 ],
  41846. "I1": [ 1494 ],
  41847. "I2": [ 1737 ],
  41848. "I3": [ 1779 ],
  41849. "O": [ 1780 ]
  41850. }
  41851. },
  41852. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  41853. "hide_name": 0,
  41854. "type": "SB_LUT4",
  41855. "parameters": {
  41856. "LUT_INIT": "0011111100101010"
  41857. },
  41858. "attributes": {
  41859. "module_not_derived": "00000000000000000000000000000001",
  41860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41861. },
  41862. "port_directions": {
  41863. "I0": "input",
  41864. "I1": "input",
  41865. "I2": "input",
  41866. "I3": "input",
  41867. "O": "output"
  41868. },
  41869. "connections": {
  41870. "I0": [ 1518 ],
  41871. "I1": [ 1494 ],
  41872. "I2": [ 1737 ],
  41873. "I3": [ 1774 ],
  41874. "O": [ 1525 ]
  41875. }
  41876. },
  41877. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_1_O_SB_LUT4_O": {
  41878. "hide_name": 0,
  41879. "type": "SB_LUT4",
  41880. "parameters": {
  41881. "LUT_INIT": "1000000000000000"
  41882. },
  41883. "attributes": {
  41884. "module_not_derived": "00000000000000000000000000000001",
  41885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41886. },
  41887. "port_directions": {
  41888. "I0": "input",
  41889. "I1": "input",
  41890. "I2": "input",
  41891. "I3": "input",
  41892. "O": "output"
  41893. },
  41894. "connections": {
  41895. "I0": [ 1776 ],
  41896. "I1": [ 1771 ],
  41897. "I2": [ 1767 ],
  41898. "I3": [ 1772 ],
  41899. "O": [ 1527 ]
  41900. }
  41901. },
  41902. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_1_O_SB_LUT4_O_1": {
  41903. "hide_name": 0,
  41904. "type": "SB_LUT4",
  41905. "parameters": {
  41906. "LUT_INIT": "1000000000000000"
  41907. },
  41908. "attributes": {
  41909. "module_not_derived": "00000000000000000000000000000001",
  41910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  41911. },
  41912. "port_directions": {
  41913. "I0": "input",
  41914. "I1": "input",
  41915. "I2": "input",
  41916. "I3": "input",
  41917. "O": "output"
  41918. },
  41919. "connections": {
  41920. "I0": [ 1754 ],
  41921. "I1": [ 1780 ],
  41922. "I2": [ 1781 ],
  41923. "I3": [ 1727 ],
  41924. "O": [ 1526 ]
  41925. }
  41926. },
  41927. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_1_O_SB_LUT4_O_2": {
  41928. "hide_name": 0,
  41929. "type": "SB_LUT4",
  41930. "parameters": {
  41931. "LUT_INIT": "0000000000001111"
  41932. },
  41933. "attributes": {
  41934. "module_not_derived": "00000000000000000000000000000001",
  41935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  41936. },
  41937. "port_directions": {
  41938. "I0": "input",
  41939. "I1": "input",
  41940. "I2": "input",
  41941. "I3": "input",
  41942. "O": "output"
  41943. },
  41944. "connections": {
  41945. "I0": [ "0" ],
  41946. "I1": [ "0" ],
  41947. "I2": [ 1512 ],
  41948. "I3": [ 1779 ],
  41949. "O": [ 1524 ]
  41950. }
  41951. },
  41952. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_I3_SB_LUT4_O": {
  41953. "hide_name": 0,
  41954. "type": "SB_LUT4",
  41955. "parameters": {
  41956. "LUT_INIT": "0000111100110011"
  41957. },
  41958. "attributes": {
  41959. "module_not_derived": "00000000000000000000000000000001",
  41960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  41961. },
  41962. "port_directions": {
  41963. "I0": "input",
  41964. "I1": "input",
  41965. "I2": "input",
  41966. "I3": "input",
  41967. "O": "output"
  41968. },
  41969. "connections": {
  41970. "I0": [ "0" ],
  41971. "I1": [ 1782 ],
  41972. "I2": [ 1783 ],
  41973. "I3": [ 1556 ],
  41974. "O": [ 1779 ]
  41975. }
  41976. },
  41977. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_1_SB_DFF_Q": {
  41978. "hide_name": 0,
  41979. "type": "SB_DFF",
  41980. "parameters": {
  41981. },
  41982. "attributes": {
  41983. "module_not_derived": "00000000000000000000000000000001",
  41984. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  41985. },
  41986. "port_directions": {
  41987. "C": "input",
  41988. "D": "input",
  41989. "Q": "output"
  41990. },
  41991. "connections": {
  41992. "C": [ 42 ],
  41993. "D": [ 1587 ],
  41994. "Q": [ 1703 ]
  41995. }
  41996. },
  41997. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_1_SB_LUT4_I1": {
  41998. "hide_name": 0,
  41999. "type": "SB_LUT4",
  42000. "parameters": {
  42001. "LUT_INIT": "1100000000110000"
  42002. },
  42003. "attributes": {
  42004. "module_not_derived": "00000000000000000000000000000001",
  42005. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  42006. },
  42007. "port_directions": {
  42008. "I0": "input",
  42009. "I1": "input",
  42010. "I2": "input",
  42011. "I3": "input",
  42012. "O": "output"
  42013. },
  42014. "connections": {
  42015. "I0": [ "0" ],
  42016. "I1": [ 1703 ],
  42017. "I2": [ 1600 ],
  42018. "I3": [ 1410 ],
  42019. "O": [ 1784 ]
  42020. }
  42021. },
  42022. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_2_SB_DFF_Q": {
  42023. "hide_name": 0,
  42024. "type": "SB_DFF",
  42025. "parameters": {
  42026. },
  42027. "attributes": {
  42028. "module_not_derived": "00000000000000000000000000000001",
  42029. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42030. },
  42031. "port_directions": {
  42032. "C": "input",
  42033. "D": "input",
  42034. "Q": "output"
  42035. },
  42036. "connections": {
  42037. "C": [ 42 ],
  42038. "D": [ 1592 ],
  42039. "Q": [ 1702 ]
  42040. }
  42041. },
  42042. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_2_SB_LUT4_I2": {
  42043. "hide_name": 0,
  42044. "type": "SB_LUT4",
  42045. "parameters": {
  42046. "LUT_INIT": "0000111111110000"
  42047. },
  42048. "attributes": {
  42049. "module_not_derived": "00000000000000000000000000000001",
  42050. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  42051. },
  42052. "port_directions": {
  42053. "I0": "input",
  42054. "I1": "input",
  42055. "I2": "input",
  42056. "I3": "input",
  42057. "O": "output"
  42058. },
  42059. "connections": {
  42060. "I0": [ "0" ],
  42061. "I1": [ "0" ],
  42062. "I2": [ 1702 ],
  42063. "I3": [ 1419 ],
  42064. "O": [ 1785 ]
  42065. }
  42066. },
  42067. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_2_SB_LUT4_I2_O_SB_DFF_Q": {
  42068. "hide_name": 0,
  42069. "type": "SB_DFF",
  42070. "parameters": {
  42071. },
  42072. "attributes": {
  42073. "module_not_derived": "00000000000000000000000000000001",
  42074. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42075. },
  42076. "port_directions": {
  42077. "C": "input",
  42078. "D": "input",
  42079. "Q": "output"
  42080. },
  42081. "connections": {
  42082. "C": [ 42 ],
  42083. "D": [ 1590 ],
  42084. "Q": [ 1706 ]
  42085. }
  42086. },
  42087. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_2_SB_LUT4_I2_O_SB_LUT4_O": {
  42088. "hide_name": 0,
  42089. "type": "SB_LUT4",
  42090. "parameters": {
  42091. "LUT_INIT": "0000000011110000"
  42092. },
  42093. "attributes": {
  42094. "module_not_derived": "00000000000000000000000000000001",
  42095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  42096. },
  42097. "port_directions": {
  42098. "I0": "input",
  42099. "I1": "input",
  42100. "I2": "input",
  42101. "I3": "input",
  42102. "O": "output"
  42103. },
  42104. "connections": {
  42105. "I0": [ "0" ],
  42106. "I1": [ "0" ],
  42107. "I2": [ 1705 ],
  42108. "I3": [ 1387 ],
  42109. "O": [ 1786 ]
  42110. }
  42111. },
  42112. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_3_SB_DFF_Q": {
  42113. "hide_name": 0,
  42114. "type": "SB_DFF",
  42115. "parameters": {
  42116. },
  42117. "attributes": {
  42118. "module_not_derived": "00000000000000000000000000000001",
  42119. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42120. },
  42121. "port_directions": {
  42122. "C": "input",
  42123. "D": "input",
  42124. "Q": "output"
  42125. },
  42126. "connections": {
  42127. "C": [ 42 ],
  42128. "D": [ 1589 ],
  42129. "Q": [ 1705 ]
  42130. }
  42131. },
  42132. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_4_SB_DFF_Q": {
  42133. "hide_name": 0,
  42134. "type": "SB_DFF",
  42135. "parameters": {
  42136. },
  42137. "attributes": {
  42138. "module_not_derived": "00000000000000000000000000000001",
  42139. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42140. },
  42141. "port_directions": {
  42142. "C": "input",
  42143. "D": "input",
  42144. "Q": "output"
  42145. },
  42146. "connections": {
  42147. "C": [ 42 ],
  42148. "D": [ 1591 ],
  42149. "Q": [ 1707 ]
  42150. }
  42151. },
  42152. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_SB_DFF_Q": {
  42153. "hide_name": 0,
  42154. "type": "SB_DFF",
  42155. "parameters": {
  42156. },
  42157. "attributes": {
  42158. "module_not_derived": "00000000000000000000000000000001",
  42159. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42160. },
  42161. "port_directions": {
  42162. "C": "input",
  42163. "D": "input",
  42164. "Q": "output"
  42165. },
  42166. "connections": {
  42167. "C": [ 42 ],
  42168. "D": [ 1588 ],
  42169. "Q": [ 1704 ]
  42170. }
  42171. },
  42172. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_SB_LUT4_I1": {
  42173. "hide_name": 0,
  42174. "type": "SB_LUT4",
  42175. "parameters": {
  42176. "LUT_INIT": "1000110000100011"
  42177. },
  42178. "attributes": {
  42179. "module_not_derived": "00000000000000000000000000000001",
  42180. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42181. },
  42182. "port_directions": {
  42183. "I0": "input",
  42184. "I1": "input",
  42185. "I2": "input",
  42186. "I3": "input",
  42187. "O": "output"
  42188. },
  42189. "connections": {
  42190. "I0": [ 1707 ],
  42191. "I1": [ 1704 ],
  42192. "I2": [ 1369 ],
  42193. "I3": [ 1400 ],
  42194. "O": [ 1787 ]
  42195. }
  42196. },
  42197. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_SB_LUT4_I1_O_SB_LUT4_O": {
  42198. "hide_name": 0,
  42199. "type": "SB_LUT4",
  42200. "parameters": {
  42201. "LUT_INIT": "0000000000001001"
  42202. },
  42203. "attributes": {
  42204. "module_not_derived": "00000000000000000000000000000001",
  42205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42206. },
  42207. "port_directions": {
  42208. "I0": "input",
  42209. "I1": "input",
  42210. "I2": "input",
  42211. "I3": "input",
  42212. "O": "output"
  42213. },
  42214. "connections": {
  42215. "I0": [ 1706 ],
  42216. "I1": [ 1372 ],
  42217. "I2": [ 1785 ],
  42218. "I3": [ 1786 ],
  42219. "O": [ 1788 ]
  42220. }
  42221. },
  42222. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_SB_LUT4_I1_O_SB_LUT4_O_1": {
  42223. "hide_name": 0,
  42224. "type": "SB_LUT4",
  42225. "parameters": {
  42226. "LUT_INIT": "1100111101000101"
  42227. },
  42228. "attributes": {
  42229. "module_not_derived": "00000000000000000000000000000001",
  42230. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42231. },
  42232. "port_directions": {
  42233. "I0": "input",
  42234. "I1": "input",
  42235. "I2": "input",
  42236. "I3": "input",
  42237. "O": "output"
  42238. },
  42239. "connections": {
  42240. "I0": [ 1707 ],
  42241. "I1": [ 1705 ],
  42242. "I2": [ 1387 ],
  42243. "I3": [ 1369 ],
  42244. "O": [ 1789 ]
  42245. }
  42246. },
  42247. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_10_SB_DFF_Q": {
  42248. "hide_name": 0,
  42249. "type": "SB_DFF",
  42250. "parameters": {
  42251. },
  42252. "attributes": {
  42253. "module_not_derived": "00000000000000000000000000000001",
  42254. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42255. },
  42256. "port_directions": {
  42257. "C": "input",
  42258. "D": "input",
  42259. "Q": "output"
  42260. },
  42261. "connections": {
  42262. "C": [ 42 ],
  42263. "D": [ 683 ],
  42264. "Q": [ 1716 ]
  42265. }
  42266. },
  42267. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_11_SB_DFF_Q": {
  42268. "hide_name": 0,
  42269. "type": "SB_DFF",
  42270. "parameters": {
  42271. },
  42272. "attributes": {
  42273. "module_not_derived": "00000000000000000000000000000001",
  42274. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42275. },
  42276. "port_directions": {
  42277. "C": "input",
  42278. "D": "input",
  42279. "Q": "output"
  42280. },
  42281. "connections": {
  42282. "C": [ 42 ],
  42283. "D": [ 711 ],
  42284. "Q": [ 1709 ]
  42285. }
  42286. },
  42287. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_12_SB_DFF_Q": {
  42288. "hide_name": 0,
  42289. "type": "SB_DFF",
  42290. "parameters": {
  42291. },
  42292. "attributes": {
  42293. "module_not_derived": "00000000000000000000000000000001",
  42294. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42295. },
  42296. "port_directions": {
  42297. "C": "input",
  42298. "D": "input",
  42299. "Q": "output"
  42300. },
  42301. "connections": {
  42302. "C": [ 42 ],
  42303. "D": [ 713 ],
  42304. "Q": [ 1718 ]
  42305. }
  42306. },
  42307. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_13_SB_DFF_Q": {
  42308. "hide_name": 0,
  42309. "type": "SB_DFF",
  42310. "parameters": {
  42311. },
  42312. "attributes": {
  42313. "module_not_derived": "00000000000000000000000000000001",
  42314. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42315. },
  42316. "port_directions": {
  42317. "C": "input",
  42318. "D": "input",
  42319. "Q": "output"
  42320. },
  42321. "connections": {
  42322. "C": [ 42 ],
  42323. "D": [ 715 ],
  42324. "Q": [ 1711 ]
  42325. }
  42326. },
  42327. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_1_SB_DFF_Q": {
  42328. "hide_name": 0,
  42329. "type": "SB_DFF",
  42330. "parameters": {
  42331. },
  42332. "attributes": {
  42333. "module_not_derived": "00000000000000000000000000000001",
  42334. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42335. },
  42336. "port_directions": {
  42337. "C": "input",
  42338. "D": "input",
  42339. "Q": "output"
  42340. },
  42341. "connections": {
  42342. "C": [ 42 ],
  42343. "D": [ 731 ],
  42344. "Q": [ 1714 ]
  42345. }
  42346. },
  42347. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_2_SB_DFF_Q": {
  42348. "hide_name": 0,
  42349. "type": "SB_DFF",
  42350. "parameters": {
  42351. },
  42352. "attributes": {
  42353. "module_not_derived": "00000000000000000000000000000001",
  42354. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42355. },
  42356. "port_directions": {
  42357. "C": "input",
  42358. "D": "input",
  42359. "Q": "output"
  42360. },
  42361. "connections": {
  42362. "C": [ 42 ],
  42363. "D": [ 729 ],
  42364. "Q": [ 1717 ]
  42365. }
  42366. },
  42367. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_3_SB_DFF_Q": {
  42368. "hide_name": 0,
  42369. "type": "SB_DFF",
  42370. "parameters": {
  42371. },
  42372. "attributes": {
  42373. "module_not_derived": "00000000000000000000000000000001",
  42374. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42375. },
  42376. "port_directions": {
  42377. "C": "input",
  42378. "D": "input",
  42379. "Q": "output"
  42380. },
  42381. "connections": {
  42382. "C": [ 42 ],
  42383. "D": [ 727 ],
  42384. "Q": [ 1710 ]
  42385. }
  42386. },
  42387. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_4_SB_DFF_Q": {
  42388. "hide_name": 0,
  42389. "type": "SB_DFF",
  42390. "parameters": {
  42391. },
  42392. "attributes": {
  42393. "module_not_derived": "00000000000000000000000000000001",
  42394. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42395. },
  42396. "port_directions": {
  42397. "C": "input",
  42398. "D": "input",
  42399. "Q": "output"
  42400. },
  42401. "connections": {
  42402. "C": [ 42 ],
  42403. "D": [ 725 ],
  42404. "Q": [ 1719 ]
  42405. }
  42406. },
  42407. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_5_SB_DFF_Q": {
  42408. "hide_name": 0,
  42409. "type": "SB_DFF",
  42410. "parameters": {
  42411. },
  42412. "attributes": {
  42413. "module_not_derived": "00000000000000000000000000000001",
  42414. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42415. },
  42416. "port_directions": {
  42417. "C": "input",
  42418. "D": "input",
  42419. "Q": "output"
  42420. },
  42421. "connections": {
  42422. "C": [ 42 ],
  42423. "D": [ 723 ],
  42424. "Q": [ 1712 ]
  42425. }
  42426. },
  42427. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_6_SB_DFF_Q": {
  42428. "hide_name": 0,
  42429. "type": "SB_DFF",
  42430. "parameters": {
  42431. },
  42432. "attributes": {
  42433. "module_not_derived": "00000000000000000000000000000001",
  42434. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42435. },
  42436. "port_directions": {
  42437. "C": "input",
  42438. "D": "input",
  42439. "Q": "output"
  42440. },
  42441. "connections": {
  42442. "C": [ 42 ],
  42443. "D": [ 721 ],
  42444. "Q": [ 1715 ]
  42445. }
  42446. },
  42447. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_7_SB_DFF_Q": {
  42448. "hide_name": 0,
  42449. "type": "SB_DFF",
  42450. "parameters": {
  42451. },
  42452. "attributes": {
  42453. "module_not_derived": "00000000000000000000000000000001",
  42454. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42455. },
  42456. "port_directions": {
  42457. "C": "input",
  42458. "D": "input",
  42459. "Q": "output"
  42460. },
  42461. "connections": {
  42462. "C": [ 42 ],
  42463. "D": [ 719 ],
  42464. "Q": [ 1708 ]
  42465. }
  42466. },
  42467. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_8_SB_DFF_Q": {
  42468. "hide_name": 0,
  42469. "type": "SB_DFF",
  42470. "parameters": {
  42471. },
  42472. "attributes": {
  42473. "module_not_derived": "00000000000000000000000000000001",
  42474. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42475. },
  42476. "port_directions": {
  42477. "C": "input",
  42478. "D": "input",
  42479. "Q": "output"
  42480. },
  42481. "connections": {
  42482. "C": [ 42 ],
  42483. "D": [ 709 ],
  42484. "Q": [ 1720 ]
  42485. }
  42486. },
  42487. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_9_SB_DFF_Q": {
  42488. "hide_name": 0,
  42489. "type": "SB_DFF",
  42490. "parameters": {
  42491. },
  42492. "attributes": {
  42493. "module_not_derived": "00000000000000000000000000000001",
  42494. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42495. },
  42496. "port_directions": {
  42497. "C": "input",
  42498. "D": "input",
  42499. "Q": "output"
  42500. },
  42501. "connections": {
  42502. "C": [ 42 ],
  42503. "D": [ 686 ],
  42504. "Q": [ 1713 ]
  42505. }
  42506. },
  42507. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_SB_DFF_Q": {
  42508. "hide_name": 0,
  42509. "type": "SB_DFF",
  42510. "parameters": {
  42511. },
  42512. "attributes": {
  42513. "module_not_derived": "00000000000000000000000000000001",
  42514. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42515. },
  42516. "port_directions": {
  42517. "C": "input",
  42518. "D": "input",
  42519. "Q": "output"
  42520. },
  42521. "connections": {
  42522. "C": [ 42 ],
  42523. "D": [ 688 ],
  42524. "Q": [ 1721 ]
  42525. }
  42526. },
  42527. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1": {
  42528. "hide_name": 0,
  42529. "type": "SB_RAM40_4K",
  42530. "parameters": {
  42531. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42532. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42533. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42534. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42535. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42536. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42537. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42538. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42539. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42540. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42541. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42542. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42543. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42544. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42545. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42546. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  42547. "READ_MODE": "00",
  42548. "WRITE_MODE": "00"
  42549. },
  42550. "attributes": {
  42551. "module_not_derived": "00000000000000000000000000000001",
  42552. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  42553. },
  42554. "port_directions": {
  42555. "MASK": "input",
  42556. "RADDR": "input",
  42557. "RCLK": "input",
  42558. "RCLKE": "input",
  42559. "RDATA": "output",
  42560. "RE": "input",
  42561. "WADDR": "input",
  42562. "WCLK": "input",
  42563. "WCLKE": "input",
  42564. "WDATA": "input",
  42565. "WE": "input"
  42566. },
  42567. "connections": {
  42568. "MASK": [ 1601, "1", 1601, "1", 1601, "1", 1601, "1", 1601, "1", 1601, "1", 1601, "1", "1", "1" ],
  42569. "RADDR": [ 1419, 1410, 1400, 1387, 1372, 1369, "0", "0", "0", "0", "0" ],
  42570. "RCLK": [ 42 ],
  42571. "RCLKE": [ 1472 ],
  42572. "RDATA": [ 1790, 1791, 1743, 1792, 1782, 1793, 1554, 1794, 1795, 1796, 1728, 1797, 1798, 1799, 1800, 1801 ],
  42573. "RE": [ "1" ],
  42574. "WADDR": [ 1702, 1703, 1704, 1705, 1706, 1707, "0", "0", "0", "0", "0" ],
  42575. "WCLK": [ 42 ],
  42576. "WCLKE": [ 1600 ],
  42577. "WDATA": [ 1802, "0", 1803, "0", 1804, "0", 1805, "0", 1806, "0", 1807, "0", 1808, "0", "0", "0" ],
  42578. "WE": [ "1" ]
  42579. }
  42580. },
  42581. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_1_SB_DFFE_Q": {
  42582. "hide_name": 0,
  42583. "type": "SB_DFFE",
  42584. "parameters": {
  42585. },
  42586. "attributes": {
  42587. "module_not_derived": "00000000000000000000000000000001",
  42588. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42589. },
  42590. "port_directions": {
  42591. "C": "input",
  42592. "D": "input",
  42593. "E": "input",
  42594. "Q": "output"
  42595. },
  42596. "connections": {
  42597. "C": [ 42 ],
  42598. "D": [ 1807 ],
  42599. "E": [ 1472 ],
  42600. "Q": [ 1729 ]
  42601. }
  42602. },
  42603. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_2_SB_DFFE_Q": {
  42604. "hide_name": 0,
  42605. "type": "SB_DFFE",
  42606. "parameters": {
  42607. },
  42608. "attributes": {
  42609. "module_not_derived": "00000000000000000000000000000001",
  42610. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42611. },
  42612. "port_directions": {
  42613. "C": "input",
  42614. "D": "input",
  42615. "E": "input",
  42616. "Q": "output"
  42617. },
  42618. "connections": {
  42619. "C": [ 42 ],
  42620. "D": [ 1806 ],
  42621. "E": [ 1472 ],
  42622. "Q": [ 1809 ]
  42623. }
  42624. },
  42625. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_2_SB_LUT4_I1": {
  42626. "hide_name": 0,
  42627. "type": "SB_LUT4",
  42628. "parameters": {
  42629. "LUT_INIT": "0000111100110011"
  42630. },
  42631. "attributes": {
  42632. "module_not_derived": "00000000000000000000000000000001",
  42633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  42634. },
  42635. "port_directions": {
  42636. "I0": "input",
  42637. "I1": "input",
  42638. "I2": "input",
  42639. "I3": "input",
  42640. "O": "output"
  42641. },
  42642. "connections": {
  42643. "I0": [ "0" ],
  42644. "I1": [ 1795 ],
  42645. "I2": [ 1809 ],
  42646. "I3": [ 1556 ],
  42647. "O": [ 1810 ]
  42648. }
  42649. },
  42650. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_3_SB_DFFE_Q": {
  42651. "hide_name": 0,
  42652. "type": "SB_DFFE",
  42653. "parameters": {
  42654. },
  42655. "attributes": {
  42656. "module_not_derived": "00000000000000000000000000000001",
  42657. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42658. },
  42659. "port_directions": {
  42660. "C": "input",
  42661. "D": "input",
  42662. "E": "input",
  42663. "Q": "output"
  42664. },
  42665. "connections": {
  42666. "C": [ 42 ],
  42667. "D": [ 1805 ],
  42668. "E": [ 1472 ],
  42669. "Q": [ 1555 ]
  42670. }
  42671. },
  42672. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_4_SB_DFFE_Q": {
  42673. "hide_name": 0,
  42674. "type": "SB_DFFE",
  42675. "parameters": {
  42676. },
  42677. "attributes": {
  42678. "module_not_derived": "00000000000000000000000000000001",
  42679. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42680. },
  42681. "port_directions": {
  42682. "C": "input",
  42683. "D": "input",
  42684. "E": "input",
  42685. "Q": "output"
  42686. },
  42687. "connections": {
  42688. "C": [ 42 ],
  42689. "D": [ 1811 ],
  42690. "E": [ 1472 ],
  42691. "Q": [ 1556 ]
  42692. }
  42693. },
  42694. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_4_SB_DFFE_Q_1": {
  42695. "hide_name": 0,
  42696. "type": "SB_DFFE",
  42697. "parameters": {
  42698. },
  42699. "attributes": {
  42700. "module_not_derived": "00000000000000000000000000000001",
  42701. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42702. },
  42703. "port_directions": {
  42704. "C": "input",
  42705. "D": "input",
  42706. "E": "input",
  42707. "Q": "output"
  42708. },
  42709. "connections": {
  42710. "C": [ 42 ],
  42711. "D": [ 1804 ],
  42712. "E": [ 1472 ],
  42713. "Q": [ 1783 ]
  42714. }
  42715. },
  42716. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_4_SB_DFFE_Q_D_SB_LUT4_O": {
  42717. "hide_name": 0,
  42718. "type": "SB_LUT4",
  42719. "parameters": {
  42720. "LUT_INIT": "1000000000000000"
  42721. },
  42722. "attributes": {
  42723. "module_not_derived": "00000000000000000000000000000001",
  42724. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42725. },
  42726. "port_directions": {
  42727. "I0": "input",
  42728. "I1": "input",
  42729. "I2": "input",
  42730. "I3": "input",
  42731. "O": "output"
  42732. },
  42733. "connections": {
  42734. "I0": [ 1789 ],
  42735. "I1": [ 1784 ],
  42736. "I2": [ 1787 ],
  42737. "I3": [ 1788 ],
  42738. "O": [ 1811 ]
  42739. }
  42740. },
  42741. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_5_SB_DFFE_Q": {
  42742. "hide_name": 0,
  42743. "type": "SB_DFFE",
  42744. "parameters": {
  42745. },
  42746. "attributes": {
  42747. "module_not_derived": "00000000000000000000000000000001",
  42748. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42749. },
  42750. "port_directions": {
  42751. "C": "input",
  42752. "D": "input",
  42753. "E": "input",
  42754. "Q": "output"
  42755. },
  42756. "connections": {
  42757. "C": [ 42 ],
  42758. "D": [ 1803 ],
  42759. "E": [ 1472 ],
  42760. "Q": [ 1744 ]
  42761. }
  42762. },
  42763. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7_SB_DFFE_Q": {
  42764. "hide_name": 0,
  42765. "type": "SB_DFFE",
  42766. "parameters": {
  42767. },
  42768. "attributes": {
  42769. "module_not_derived": "00000000000000000000000000000001",
  42770. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42771. },
  42772. "port_directions": {
  42773. "C": "input",
  42774. "D": "input",
  42775. "E": "input",
  42776. "Q": "output"
  42777. },
  42778. "connections": {
  42779. "C": [ 42 ],
  42780. "D": [ 1802 ],
  42781. "E": [ 1472 ],
  42782. "Q": [ 1812 ]
  42783. }
  42784. },
  42785. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7_SB_LUT4_I1": {
  42786. "hide_name": 0,
  42787. "type": "SB_LUT4",
  42788. "parameters": {
  42789. "LUT_INIT": "0000111100110011"
  42790. },
  42791. "attributes": {
  42792. "module_not_derived": "00000000000000000000000000000001",
  42793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  42794. },
  42795. "port_directions": {
  42796. "I0": "input",
  42797. "I1": "input",
  42798. "I2": "input",
  42799. "I3": "input",
  42800. "O": "output"
  42801. },
  42802. "connections": {
  42803. "I0": [ "0" ],
  42804. "I1": [ 1790 ],
  42805. "I2": [ 1812 ],
  42806. "I3": [ 1556 ],
  42807. "O": [ 1813 ]
  42808. }
  42809. },
  42810. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I2": {
  42811. "hide_name": 0,
  42812. "type": "SB_LUT4",
  42813. "parameters": {
  42814. "LUT_INIT": "0000000000111111"
  42815. },
  42816. "attributes": {
  42817. "module_not_derived": "00000000000000000000000000000001",
  42818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  42819. },
  42820. "port_directions": {
  42821. "I0": "input",
  42822. "I1": "input",
  42823. "I2": "input",
  42824. "I3": "input",
  42825. "O": "output"
  42826. },
  42827. "connections": {
  42828. "I0": [ "0" ],
  42829. "I1": [ 1516 ],
  42830. "I2": [ 1813 ],
  42831. "I3": [ 1731 ],
  42832. "O": [ 1762 ]
  42833. }
  42834. },
  42835. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  42836. "hide_name": 0,
  42837. "type": "SB_LUT4",
  42838. "parameters": {
  42839. "LUT_INIT": "0101111101001100"
  42840. },
  42841. "attributes": {
  42842. "module_not_derived": "00000000000000000000000000000001",
  42843. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42844. },
  42845. "port_directions": {
  42846. "I0": "input",
  42847. "I1": "input",
  42848. "I2": "input",
  42849. "I3": "input",
  42850. "O": "output"
  42851. },
  42852. "connections": {
  42853. "I0": [ 1514 ],
  42854. "I1": [ 1516 ],
  42855. "I2": [ 1810 ],
  42856. "I3": [ 1813 ],
  42857. "O": [ 1781 ]
  42858. }
  42859. },
  42860. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I3": {
  42861. "hide_name": 0,
  42862. "type": "SB_LUT4",
  42863. "parameters": {
  42864. "LUT_INIT": "0000000000001111"
  42865. },
  42866. "attributes": {
  42867. "module_not_derived": "00000000000000000000000000000001",
  42868. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  42869. },
  42870. "port_directions": {
  42871. "I0": "input",
  42872. "I1": "input",
  42873. "I2": "input",
  42874. "I3": "input",
  42875. "O": "output"
  42876. },
  42877. "connections": {
  42878. "I0": [ "0" ],
  42879. "I1": [ "0" ],
  42880. "I2": [ 1514 ],
  42881. "I3": [ 1810 ],
  42882. "O": [ 1761 ]
  42883. }
  42884. },
  42885. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_SB_DFFE_Q": {
  42886. "hide_name": 0,
  42887. "type": "SB_DFFE",
  42888. "parameters": {
  42889. },
  42890. "attributes": {
  42891. "module_not_derived": "00000000000000000000000000000001",
  42892. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  42893. },
  42894. "port_directions": {
  42895. "C": "input",
  42896. "D": "input",
  42897. "E": "input",
  42898. "Q": "output"
  42899. },
  42900. "connections": {
  42901. "C": [ 42 ],
  42902. "D": [ 1808 ],
  42903. "E": [ 1472 ],
  42904. "Q": [ 1814 ]
  42905. }
  42906. },
  42907. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_SB_LUT4_I0": {
  42908. "hide_name": 0,
  42909. "type": "SB_LUT4",
  42910. "parameters": {
  42911. "LUT_INIT": "0011010111001010"
  42912. },
  42913. "attributes": {
  42914. "module_not_derived": "00000000000000000000000000000001",
  42915. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42916. },
  42917. "port_directions": {
  42918. "I0": "input",
  42919. "I1": "input",
  42920. "I2": "input",
  42921. "I3": "input",
  42922. "O": "output"
  42923. },
  42924. "connections": {
  42925. "I0": [ 1798 ],
  42926. "I1": [ 1814 ],
  42927. "I2": [ 1556 ],
  42928. "I3": [ 1510 ],
  42929. "O": [ 1768 ]
  42930. }
  42931. },
  42932. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_SB_LUT4_I0_O_SB_LUT4_O": {
  42933. "hide_name": 0,
  42934. "type": "SB_LUT4",
  42935. "parameters": {
  42936. "LUT_INIT": "0000000011001010"
  42937. },
  42938. "attributes": {
  42939. "module_not_derived": "00000000000000000000000000000001",
  42940. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  42941. },
  42942. "port_directions": {
  42943. "I0": "input",
  42944. "I1": "input",
  42945. "I2": "input",
  42946. "I3": "input",
  42947. "O": "output"
  42948. },
  42949. "connections": {
  42950. "I0": [ 1686 ],
  42951. "I1": [ 1738 ],
  42952. "I2": [ 1556 ],
  42953. "I3": [ 1739 ],
  42954. "O": [ 1770 ]
  42955. }
  42956. },
  42957. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_1_SB_DFF_Q": {
  42958. "hide_name": 0,
  42959. "type": "SB_DFF",
  42960. "parameters": {
  42961. },
  42962. "attributes": {
  42963. "module_not_derived": "00000000000000000000000000000001",
  42964. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42965. },
  42966. "port_directions": {
  42967. "C": "input",
  42968. "D": "input",
  42969. "Q": "output"
  42970. },
  42971. "connections": {
  42972. "C": [ 42 ],
  42973. "D": [ 737 ],
  42974. "Q": [ 1807 ]
  42975. }
  42976. },
  42977. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_2_SB_DFF_Q": {
  42978. "hide_name": 0,
  42979. "type": "SB_DFF",
  42980. "parameters": {
  42981. },
  42982. "attributes": {
  42983. "module_not_derived": "00000000000000000000000000000001",
  42984. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  42985. },
  42986. "port_directions": {
  42987. "C": "input",
  42988. "D": "input",
  42989. "Q": "output"
  42990. },
  42991. "connections": {
  42992. "C": [ 42 ],
  42993. "D": [ 1560 ],
  42994. "Q": [ 1803 ]
  42995. }
  42996. },
  42997. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_3_SB_DFF_Q": {
  42998. "hide_name": 0,
  42999. "type": "SB_DFF",
  43000. "parameters": {
  43001. },
  43002. "attributes": {
  43003. "module_not_derived": "00000000000000000000000000000001",
  43004. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  43005. },
  43006. "port_directions": {
  43007. "C": "input",
  43008. "D": "input",
  43009. "Q": "output"
  43010. },
  43011. "connections": {
  43012. "C": [ 42 ],
  43013. "D": [ 1564 ],
  43014. "Q": [ 1808 ]
  43015. }
  43016. },
  43017. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_4_SB_DFF_Q": {
  43018. "hide_name": 0,
  43019. "type": "SB_DFF",
  43020. "parameters": {
  43021. },
  43022. "attributes": {
  43023. "module_not_derived": "00000000000000000000000000000001",
  43024. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  43025. },
  43026. "port_directions": {
  43027. "C": "input",
  43028. "D": "input",
  43029. "Q": "output"
  43030. },
  43031. "connections": {
  43032. "C": [ 42 ],
  43033. "D": [ 1565 ],
  43034. "Q": [ 1804 ]
  43035. }
  43036. },
  43037. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_5_SB_DFF_Q": {
  43038. "hide_name": 0,
  43039. "type": "SB_DFF",
  43040. "parameters": {
  43041. },
  43042. "attributes": {
  43043. "module_not_derived": "00000000000000000000000000000001",
  43044. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  43045. },
  43046. "port_directions": {
  43047. "C": "input",
  43048. "D": "input",
  43049. "Q": "output"
  43050. },
  43051. "connections": {
  43052. "C": [ 42 ],
  43053. "D": [ 1566 ],
  43054. "Q": [ 1806 ]
  43055. }
  43056. },
  43057. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_6_SB_DFF_Q": {
  43058. "hide_name": 0,
  43059. "type": "SB_DFF",
  43060. "parameters": {
  43061. },
  43062. "attributes": {
  43063. "module_not_derived": "00000000000000000000000000000001",
  43064. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  43065. },
  43066. "port_directions": {
  43067. "C": "input",
  43068. "D": "input",
  43069. "Q": "output"
  43070. },
  43071. "connections": {
  43072. "C": [ 42 ],
  43073. "D": [ 690 ],
  43074. "Q": [ 1802 ]
  43075. }
  43076. },
  43077. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_SB_DFF_Q": {
  43078. "hide_name": 0,
  43079. "type": "SB_DFF",
  43080. "parameters": {
  43081. },
  43082. "attributes": {
  43083. "module_not_derived": "00000000000000000000000000000001",
  43084. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  43085. },
  43086. "port_directions": {
  43087. "C": "input",
  43088. "D": "input",
  43089. "Q": "output"
  43090. },
  43091. "connections": {
  43092. "C": [ 42 ],
  43093. "D": [ 1559 ],
  43094. "Q": [ 1805 ]
  43095. }
  43096. },
  43097. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3": {
  43098. "hide_name": 0,
  43099. "type": "SB_LUT4",
  43100. "parameters": {
  43101. "LUT_INIT": "1111000000000000"
  43102. },
  43103. "attributes": {
  43104. "module_not_derived": "00000000000000000000000000000001",
  43105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  43106. },
  43107. "port_directions": {
  43108. "I0": "input",
  43109. "I1": "input",
  43110. "I2": "input",
  43111. "I3": "input",
  43112. "O": "output"
  43113. },
  43114. "connections": {
  43115. "I0": [ "0" ],
  43116. "I1": [ "0" ],
  43117. "I2": [ 1365 ],
  43118. "I3": [ 1815 ],
  43119. "O": [ 1471 ]
  43120. }
  43121. },
  43122. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3_O_SB_CARRY_CO": {
  43123. "hide_name": 0,
  43124. "type": "SB_CARRY",
  43125. "parameters": {
  43126. },
  43127. "attributes": {
  43128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1482.22-1482.41|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  43129. },
  43130. "port_directions": {
  43131. "CI": "input",
  43132. "CO": "output",
  43133. "I0": "input",
  43134. "I1": "input"
  43135. },
  43136. "connections": {
  43137. "CI": [ 1023 ],
  43138. "CO": [ 1816 ],
  43139. "I0": [ 1391 ],
  43140. "I1": [ "1" ]
  43141. }
  43142. },
  43143. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3_O_SB_LUT4_I1": {
  43144. "hide_name": 0,
  43145. "type": "SB_LUT4",
  43146. "parameters": {
  43147. "LUT_INIT": "1000010001001000"
  43148. },
  43149. "attributes": {
  43150. "module_not_derived": "00000000000000000000000000000001",
  43151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1482.22-1482.41|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  43152. },
  43153. "port_directions": {
  43154. "I0": "input",
  43155. "I1": "input",
  43156. "I2": "input",
  43157. "I3": "input",
  43158. "O": "output"
  43159. },
  43160. "connections": {
  43161. "I0": [ "0" ],
  43162. "I1": [ 1471 ],
  43163. "I2": [ "1" ],
  43164. "I3": [ 1816 ],
  43165. "O": [ 1367 ]
  43166. }
  43167. },
  43168. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3_O_SB_LUT4_I1_O_SB_LUT4_O": {
  43169. "hide_name": 0,
  43170. "type": "SB_LUT4",
  43171. "parameters": {
  43172. "LUT_INIT": "0011000011110000"
  43173. },
  43174. "attributes": {
  43175. "module_not_derived": "00000000000000000000000000000001",
  43176. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  43177. },
  43178. "port_directions": {
  43179. "I0": "input",
  43180. "I1": "input",
  43181. "I2": "input",
  43182. "I3": "input",
  43183. "O": "output"
  43184. },
  43185. "connections": {
  43186. "I0": [ "0" ],
  43187. "I1": [ 1817 ],
  43188. "I2": [ 1450 ],
  43189. "I3": [ 1375 ],
  43190. "O": [ 1818 ]
  43191. }
  43192. },
  43193. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3_O_SB_LUT4_I1_O_SB_LUT4_O_1": {
  43194. "hide_name": 0,
  43195. "type": "SB_LUT4",
  43196. "parameters": {
  43197. "LUT_INIT": "1011100000000000"
  43198. },
  43199. "attributes": {
  43200. "module_not_derived": "00000000000000000000000000000001",
  43201. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  43202. },
  43203. "port_directions": {
  43204. "I0": "input",
  43205. "I1": "input",
  43206. "I2": "input",
  43207. "I3": "input",
  43208. "O": "output"
  43209. },
  43210. "connections": {
  43211. "I0": [ 1509 ],
  43212. "I1": [ 1378 ],
  43213. "I2": [ 1819 ],
  43214. "I3": [ 1380 ],
  43215. "O": [ 1820 ]
  43216. }
  43217. },
  43218. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_O": {
  43219. "hide_name": 0,
  43220. "type": "SB_LUT4",
  43221. "parameters": {
  43222. "LUT_INIT": "0000000000111000"
  43223. },
  43224. "attributes": {
  43225. "module_not_derived": "00000000000000000000000000000001",
  43226. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  43227. },
  43228. "port_directions": {
  43229. "I0": "input",
  43230. "I1": "input",
  43231. "I2": "input",
  43232. "I3": "input",
  43233. "O": "output"
  43234. },
  43235. "connections": {
  43236. "I0": [ 1821 ],
  43237. "I1": [ 1822 ],
  43238. "I2": [ 1823 ],
  43239. "I3": [ 1824 ],
  43240. "O": [ 1815 ]
  43241. }
  43242. },
  43243. "cpu_I.IBusCachedPlugin_fetchPc_pcRegPropagate_SB_LUT4_O": {
  43244. "hide_name": 0,
  43245. "type": "SB_LUT4",
  43246. "parameters": {
  43247. "LUT_INIT": "0000111100000000"
  43248. },
  43249. "attributes": {
  43250. "module_not_derived": "00000000000000000000000000000001",
  43251. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  43252. },
  43253. "port_directions": {
  43254. "I0": "input",
  43255. "I1": "input",
  43256. "I2": "input",
  43257. "I3": "input",
  43258. "O": "output"
  43259. },
  43260. "connections": {
  43261. "I0": [ "0" ],
  43262. "I1": [ "0" ],
  43263. "I2": [ 1378 ],
  43264. "I3": [ 1475 ],
  43265. "O": [ 1472 ]
  43266. }
  43267. },
  43268. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q": {
  43269. "hide_name": 0,
  43270. "type": "SB_DFFER",
  43271. "parameters": {
  43272. },
  43273. "attributes": {
  43274. "module_not_derived": "00000000000000000000000000000001",
  43275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43276. },
  43277. "port_directions": {
  43278. "C": "input",
  43279. "D": "input",
  43280. "E": "input",
  43281. "Q": "output",
  43282. "R": "input"
  43283. },
  43284. "connections": {
  43285. "C": [ 42 ],
  43286. "D": [ 1825 ],
  43287. "E": [ 1474 ],
  43288. "Q": [ 1484 ],
  43289. "R": [ 127 ]
  43290. }
  43291. },
  43292. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_1": {
  43293. "hide_name": 0,
  43294. "type": "SB_DFFER",
  43295. "parameters": {
  43296. },
  43297. "attributes": {
  43298. "module_not_derived": "00000000000000000000000000000001",
  43299. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43300. },
  43301. "port_directions": {
  43302. "C": "input",
  43303. "D": "input",
  43304. "E": "input",
  43305. "Q": "output",
  43306. "R": "input"
  43307. },
  43308. "connections": {
  43309. "C": [ 42 ],
  43310. "D": [ 1826 ],
  43311. "E": [ 1474 ],
  43312. "Q": [ 1506 ],
  43313. "R": [ 127 ]
  43314. }
  43315. },
  43316. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_10": {
  43317. "hide_name": 0,
  43318. "type": "SB_DFFER",
  43319. "parameters": {
  43320. },
  43321. "attributes": {
  43322. "module_not_derived": "00000000000000000000000000000001",
  43323. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43324. },
  43325. "port_directions": {
  43326. "C": "input",
  43327. "D": "input",
  43328. "E": "input",
  43329. "Q": "output",
  43330. "R": "input"
  43331. },
  43332. "connections": {
  43333. "C": [ 42 ],
  43334. "D": [ 1827 ],
  43335. "E": [ 1474 ],
  43336. "Q": [ 1488 ],
  43337. "R": [ 127 ]
  43338. }
  43339. },
  43340. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_11": {
  43341. "hide_name": 0,
  43342. "type": "SB_DFFER",
  43343. "parameters": {
  43344. },
  43345. "attributes": {
  43346. "module_not_derived": "00000000000000000000000000000001",
  43347. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43348. },
  43349. "port_directions": {
  43350. "C": "input",
  43351. "D": "input",
  43352. "E": "input",
  43353. "Q": "output",
  43354. "R": "input"
  43355. },
  43356. "connections": {
  43357. "C": [ 42 ],
  43358. "D": [ 1828 ],
  43359. "E": [ 1474 ],
  43360. "Q": [ 1490 ],
  43361. "R": [ 127 ]
  43362. }
  43363. },
  43364. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_12": {
  43365. "hide_name": 0,
  43366. "type": "SB_DFFER",
  43367. "parameters": {
  43368. },
  43369. "attributes": {
  43370. "module_not_derived": "00000000000000000000000000000001",
  43371. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43372. },
  43373. "port_directions": {
  43374. "C": "input",
  43375. "D": "input",
  43376. "E": "input",
  43377. "Q": "output",
  43378. "R": "input"
  43379. },
  43380. "connections": {
  43381. "C": [ 42 ],
  43382. "D": [ 1829 ],
  43383. "E": [ 1474 ],
  43384. "Q": [ 1492 ],
  43385. "R": [ 127 ]
  43386. }
  43387. },
  43388. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_13": {
  43389. "hide_name": 0,
  43390. "type": "SB_DFFER",
  43391. "parameters": {
  43392. },
  43393. "attributes": {
  43394. "module_not_derived": "00000000000000000000000000000001",
  43395. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43396. },
  43397. "port_directions": {
  43398. "C": "input",
  43399. "D": "input",
  43400. "E": "input",
  43401. "Q": "output",
  43402. "R": "input"
  43403. },
  43404. "connections": {
  43405. "C": [ 42 ],
  43406. "D": [ 1830 ],
  43407. "E": [ 1474 ],
  43408. "Q": [ 1494 ],
  43409. "R": [ 127 ]
  43410. }
  43411. },
  43412. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_14": {
  43413. "hide_name": 0,
  43414. "type": "SB_DFFER",
  43415. "parameters": {
  43416. },
  43417. "attributes": {
  43418. "module_not_derived": "00000000000000000000000000000001",
  43419. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43420. },
  43421. "port_directions": {
  43422. "C": "input",
  43423. "D": "input",
  43424. "E": "input",
  43425. "Q": "output",
  43426. "R": "input"
  43427. },
  43428. "connections": {
  43429. "C": [ 42 ],
  43430. "D": [ 1831 ],
  43431. "E": [ 1474 ],
  43432. "Q": [ 1496 ],
  43433. "R": [ 127 ]
  43434. }
  43435. },
  43436. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_15": {
  43437. "hide_name": 0,
  43438. "type": "SB_DFFER",
  43439. "parameters": {
  43440. },
  43441. "attributes": {
  43442. "module_not_derived": "00000000000000000000000000000001",
  43443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43444. },
  43445. "port_directions": {
  43446. "C": "input",
  43447. "D": "input",
  43448. "E": "input",
  43449. "Q": "output",
  43450. "R": "input"
  43451. },
  43452. "connections": {
  43453. "C": [ 42 ],
  43454. "D": [ 1832 ],
  43455. "E": [ 1474 ],
  43456. "Q": [ 1498 ],
  43457. "R": [ 127 ]
  43458. }
  43459. },
  43460. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_16": {
  43461. "hide_name": 0,
  43462. "type": "SB_DFFER",
  43463. "parameters": {
  43464. },
  43465. "attributes": {
  43466. "module_not_derived": "00000000000000000000000000000001",
  43467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43468. },
  43469. "port_directions": {
  43470. "C": "input",
  43471. "D": "input",
  43472. "E": "input",
  43473. "Q": "output",
  43474. "R": "input"
  43475. },
  43476. "connections": {
  43477. "C": [ 42 ],
  43478. "D": [ 1833 ],
  43479. "E": [ 1474 ],
  43480. "Q": [ 1500 ],
  43481. "R": [ 127 ]
  43482. }
  43483. },
  43484. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_17": {
  43485. "hide_name": 0,
  43486. "type": "SB_DFFER",
  43487. "parameters": {
  43488. },
  43489. "attributes": {
  43490. "module_not_derived": "00000000000000000000000000000001",
  43491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43492. },
  43493. "port_directions": {
  43494. "C": "input",
  43495. "D": "input",
  43496. "E": "input",
  43497. "Q": "output",
  43498. "R": "input"
  43499. },
  43500. "connections": {
  43501. "C": [ 42 ],
  43502. "D": [ 1834 ],
  43503. "E": [ 1474 ],
  43504. "Q": [ 1502 ],
  43505. "R": [ 127 ]
  43506. }
  43507. },
  43508. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_18": {
  43509. "hide_name": 0,
  43510. "type": "SB_DFFER",
  43511. "parameters": {
  43512. },
  43513. "attributes": {
  43514. "module_not_derived": "00000000000000000000000000000001",
  43515. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43516. },
  43517. "port_directions": {
  43518. "C": "input",
  43519. "D": "input",
  43520. "E": "input",
  43521. "Q": "output",
  43522. "R": "input"
  43523. },
  43524. "connections": {
  43525. "C": [ 42 ],
  43526. "D": [ 1835 ],
  43527. "E": [ 1474 ],
  43528. "Q": [ 1504 ],
  43529. "R": [ 127 ]
  43530. }
  43531. },
  43532. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_19": {
  43533. "hide_name": 0,
  43534. "type": "SB_DFFER",
  43535. "parameters": {
  43536. },
  43537. "attributes": {
  43538. "module_not_derived": "00000000000000000000000000000001",
  43539. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43540. },
  43541. "port_directions": {
  43542. "C": "input",
  43543. "D": "input",
  43544. "E": "input",
  43545. "Q": "output",
  43546. "R": "input"
  43547. },
  43548. "connections": {
  43549. "C": [ 42 ],
  43550. "D": [ 1836 ],
  43551. "E": [ 1474 ],
  43552. "Q": [ 1508 ],
  43553. "R": [ 127 ]
  43554. }
  43555. },
  43556. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_2": {
  43557. "hide_name": 0,
  43558. "type": "SB_DFFER",
  43559. "parameters": {
  43560. },
  43561. "attributes": {
  43562. "module_not_derived": "00000000000000000000000000000001",
  43563. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43564. },
  43565. "port_directions": {
  43566. "C": "input",
  43567. "D": "input",
  43568. "E": "input",
  43569. "Q": "output",
  43570. "R": "input"
  43571. },
  43572. "connections": {
  43573. "C": [ 42 ],
  43574. "D": [ 1837 ],
  43575. "E": [ 1474 ],
  43576. "Q": [ 1510 ],
  43577. "R": [ 127 ]
  43578. }
  43579. },
  43580. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_20": {
  43581. "hide_name": 0,
  43582. "type": "SB_DFFER",
  43583. "parameters": {
  43584. },
  43585. "attributes": {
  43586. "module_not_derived": "00000000000000000000000000000001",
  43587. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43588. },
  43589. "port_directions": {
  43590. "C": "input",
  43591. "D": "input",
  43592. "E": "input",
  43593. "Q": "output",
  43594. "R": "input"
  43595. },
  43596. "connections": {
  43597. "C": [ 42 ],
  43598. "D": [ 1369 ],
  43599. "E": [ 1474 ],
  43600. "Q": [ 1434 ],
  43601. "R": [ 127 ]
  43602. }
  43603. },
  43604. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_21": {
  43605. "hide_name": 0,
  43606. "type": "SB_DFFER",
  43607. "parameters": {
  43608. },
  43609. "attributes": {
  43610. "module_not_derived": "00000000000000000000000000000001",
  43611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43612. },
  43613. "port_directions": {
  43614. "C": "input",
  43615. "D": "input",
  43616. "E": "input",
  43617. "Q": "output",
  43618. "R": "input"
  43619. },
  43620. "connections": {
  43621. "C": [ 42 ],
  43622. "D": [ 1372 ],
  43623. "E": [ 1474 ],
  43624. "Q": [ 1381 ],
  43625. "R": [ 127 ]
  43626. }
  43627. },
  43628. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_22": {
  43629. "hide_name": 0,
  43630. "type": "SB_DFFER",
  43631. "parameters": {
  43632. },
  43633. "attributes": {
  43634. "module_not_derived": "00000000000000000000000000000001",
  43635. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43636. },
  43637. "port_directions": {
  43638. "C": "input",
  43639. "D": "input",
  43640. "E": "input",
  43641. "Q": "output",
  43642. "R": "input"
  43643. },
  43644. "connections": {
  43645. "C": [ 42 ],
  43646. "D": [ 1387 ],
  43647. "E": [ 1474 ],
  43648. "Q": [ 1384 ],
  43649. "R": [ 127 ]
  43650. }
  43651. },
  43652. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_23": {
  43653. "hide_name": 0,
  43654. "type": "SB_DFFER",
  43655. "parameters": {
  43656. },
  43657. "attributes": {
  43658. "module_not_derived": "00000000000000000000000000000001",
  43659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43660. },
  43661. "port_directions": {
  43662. "C": "input",
  43663. "D": "input",
  43664. "E": "input",
  43665. "Q": "output",
  43666. "R": "input"
  43667. },
  43668. "connections": {
  43669. "C": [ 42 ],
  43670. "D": [ 1400 ],
  43671. "E": [ 1474 ],
  43672. "Q": [ 1397 ],
  43673. "R": [ 127 ]
  43674. }
  43675. },
  43676. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_24": {
  43677. "hide_name": 0,
  43678. "type": "SB_DFFER",
  43679. "parameters": {
  43680. },
  43681. "attributes": {
  43682. "module_not_derived": "00000000000000000000000000000001",
  43683. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43684. },
  43685. "port_directions": {
  43686. "C": "input",
  43687. "D": "input",
  43688. "E": "input",
  43689. "Q": "output",
  43690. "R": "input"
  43691. },
  43692. "connections": {
  43693. "C": [ 42 ],
  43694. "D": [ 1410 ],
  43695. "E": [ 1474 ],
  43696. "Q": [ 1407 ],
  43697. "R": [ 127 ]
  43698. }
  43699. },
  43700. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_25": {
  43701. "hide_name": 0,
  43702. "type": "SB_DFFER",
  43703. "parameters": {
  43704. },
  43705. "attributes": {
  43706. "module_not_derived": "00000000000000000000000000000001",
  43707. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43708. },
  43709. "port_directions": {
  43710. "C": "input",
  43711. "D": "input",
  43712. "E": "input",
  43713. "Q": "output",
  43714. "R": "input"
  43715. },
  43716. "connections": {
  43717. "C": [ 42 ],
  43718. "D": [ 1419 ],
  43719. "E": [ 1474 ],
  43720. "Q": [ 1424 ],
  43721. "R": [ 127 ]
  43722. }
  43723. },
  43724. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_26": {
  43725. "hide_name": 0,
  43726. "type": "SB_DFFER",
  43727. "parameters": {
  43728. },
  43729. "attributes": {
  43730. "module_not_derived": "00000000000000000000000000000001",
  43731. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43732. },
  43733. "port_directions": {
  43734. "C": "input",
  43735. "D": "input",
  43736. "E": "input",
  43737. "Q": "output",
  43738. "R": "input"
  43739. },
  43740. "connections": {
  43741. "C": [ 42 ],
  43742. "D": [ 1443 ],
  43743. "E": [ 1474 ],
  43744. "Q": [ 1427 ],
  43745. "R": [ 127 ]
  43746. }
  43747. },
  43748. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_27": {
  43749. "hide_name": 0,
  43750. "type": "SB_DFFER",
  43751. "parameters": {
  43752. },
  43753. "attributes": {
  43754. "module_not_derived": "00000000000000000000000000000001",
  43755. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43756. },
  43757. "port_directions": {
  43758. "C": "input",
  43759. "D": "input",
  43760. "E": "input",
  43761. "Q": "output",
  43762. "R": "input"
  43763. },
  43764. "connections": {
  43765. "C": [ 42 ],
  43766. "D": [ 1453 ],
  43767. "E": [ 1474 ],
  43768. "Q": [ 1449 ],
  43769. "R": [ 127 ]
  43770. }
  43771. },
  43772. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_28": {
  43773. "hide_name": 0,
  43774. "type": "SB_DFFER",
  43775. "parameters": {
  43776. },
  43777. "attributes": {
  43778. "module_not_derived": "00000000000000000000000000000001",
  43779. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43780. },
  43781. "port_directions": {
  43782. "C": "input",
  43783. "D": "input",
  43784. "E": "input",
  43785. "Q": "output",
  43786. "R": "input"
  43787. },
  43788. "connections": {
  43789. "C": [ 42 ],
  43790. "D": [ 1439 ],
  43791. "E": [ 1474 ],
  43792. "Q": [ 1464 ],
  43793. "R": [ 127 ]
  43794. }
  43795. },
  43796. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_3": {
  43797. "hide_name": 0,
  43798. "type": "SB_DFFER",
  43799. "parameters": {
  43800. },
  43801. "attributes": {
  43802. "module_not_derived": "00000000000000000000000000000001",
  43803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43804. },
  43805. "port_directions": {
  43806. "C": "input",
  43807. "D": "input",
  43808. "E": "input",
  43809. "Q": "output",
  43810. "R": "input"
  43811. },
  43812. "connections": {
  43813. "C": [ 42 ],
  43814. "D": [ 1838 ],
  43815. "E": [ 1474 ],
  43816. "Q": [ 1512 ],
  43817. "R": [ 127 ]
  43818. }
  43819. },
  43820. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_4": {
  43821. "hide_name": 0,
  43822. "type": "SB_DFFER",
  43823. "parameters": {
  43824. },
  43825. "attributes": {
  43826. "module_not_derived": "00000000000000000000000000000001",
  43827. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43828. },
  43829. "port_directions": {
  43830. "C": "input",
  43831. "D": "input",
  43832. "E": "input",
  43833. "Q": "output",
  43834. "R": "input"
  43835. },
  43836. "connections": {
  43837. "C": [ 42 ],
  43838. "D": [ 1839 ],
  43839. "E": [ 1474 ],
  43840. "Q": [ 1514 ],
  43841. "R": [ 127 ]
  43842. }
  43843. },
  43844. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_5": {
  43845. "hide_name": 0,
  43846. "type": "SB_DFFER",
  43847. "parameters": {
  43848. },
  43849. "attributes": {
  43850. "module_not_derived": "00000000000000000000000000000001",
  43851. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43852. },
  43853. "port_directions": {
  43854. "C": "input",
  43855. "D": "input",
  43856. "E": "input",
  43857. "Q": "output",
  43858. "R": "input"
  43859. },
  43860. "connections": {
  43861. "C": [ 42 ],
  43862. "D": [ 1840 ],
  43863. "E": [ 1474 ],
  43864. "Q": [ 1516 ],
  43865. "R": [ 127 ]
  43866. }
  43867. },
  43868. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_6": {
  43869. "hide_name": 0,
  43870. "type": "SB_DFFER",
  43871. "parameters": {
  43872. },
  43873. "attributes": {
  43874. "module_not_derived": "00000000000000000000000000000001",
  43875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43876. },
  43877. "port_directions": {
  43878. "C": "input",
  43879. "D": "input",
  43880. "E": "input",
  43881. "Q": "output",
  43882. "R": "input"
  43883. },
  43884. "connections": {
  43885. "C": [ 42 ],
  43886. "D": [ 1841 ],
  43887. "E": [ 1474 ],
  43888. "Q": [ 1518 ],
  43889. "R": [ 127 ]
  43890. }
  43891. },
  43892. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_7": {
  43893. "hide_name": 0,
  43894. "type": "SB_DFFER",
  43895. "parameters": {
  43896. },
  43897. "attributes": {
  43898. "module_not_derived": "00000000000000000000000000000001",
  43899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43900. },
  43901. "port_directions": {
  43902. "C": "input",
  43903. "D": "input",
  43904. "E": "input",
  43905. "Q": "output",
  43906. "R": "input"
  43907. },
  43908. "connections": {
  43909. "C": [ 42 ],
  43910. "D": [ 1842 ],
  43911. "E": [ 1474 ],
  43912. "Q": [ 1520 ],
  43913. "R": [ 127 ]
  43914. }
  43915. },
  43916. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_8": {
  43917. "hide_name": 0,
  43918. "type": "SB_DFFER",
  43919. "parameters": {
  43920. },
  43921. "attributes": {
  43922. "module_not_derived": "00000000000000000000000000000001",
  43923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43924. },
  43925. "port_directions": {
  43926. "C": "input",
  43927. "D": "input",
  43928. "E": "input",
  43929. "Q": "output",
  43930. "R": "input"
  43931. },
  43932. "connections": {
  43933. "C": [ 42 ],
  43934. "D": [ 1843 ],
  43935. "E": [ 1474 ],
  43936. "Q": [ 1522 ],
  43937. "R": [ 127 ]
  43938. }
  43939. },
  43940. "cpu_I.IBusCachedPlugin_fetchPc_pcReg_SB_DFFER_Q_9": {
  43941. "hide_name": 0,
  43942. "type": "SB_DFFER",
  43943. "parameters": {
  43944. },
  43945. "attributes": {
  43946. "module_not_derived": "00000000000000000000000000000001",
  43947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  43948. },
  43949. "port_directions": {
  43950. "C": "input",
  43951. "D": "input",
  43952. "E": "input",
  43953. "Q": "output",
  43954. "R": "input"
  43955. },
  43956. "connections": {
  43957. "C": [ 42 ],
  43958. "D": [ 1844 ],
  43959. "E": [ 1474 ],
  43960. "Q": [ 1486 ],
  43961. "R": [ 127 ]
  43962. }
  43963. },
  43964. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O": {
  43965. "hide_name": 0,
  43966. "type": "SB_LUT4",
  43967. "parameters": {
  43968. "LUT_INIT": "1111100011111111"
  43969. },
  43970. "attributes": {
  43971. "module_not_derived": "00000000000000000000000000000001",
  43972. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  43973. },
  43974. "port_directions": {
  43975. "I0": "input",
  43976. "I1": "input",
  43977. "I2": "input",
  43978. "I3": "input",
  43979. "O": "output"
  43980. },
  43981. "connections": {
  43982. "I0": [ 1845 ],
  43983. "I1": [ 1367 ],
  43984. "I2": [ 1820 ],
  43985. "I3": [ 1818 ],
  43986. "O": [ 1836 ]
  43987. }
  43988. },
  43989. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1": {
  43990. "hide_name": 0,
  43991. "type": "SB_LUT4",
  43992. "parameters": {
  43993. "LUT_INIT": "1111100011111111"
  43994. },
  43995. "attributes": {
  43996. "module_not_derived": "00000000000000000000000000000001",
  43997. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  43998. },
  43999. "port_directions": {
  44000. "I0": "input",
  44001. "I1": "input",
  44002. "I2": "input",
  44003. "I3": "input",
  44004. "O": "output"
  44005. },
  44006. "connections": {
  44007. "I0": [ 1846 ],
  44008. "I1": [ 1367 ],
  44009. "I2": [ 1847 ],
  44010. "I3": [ 1848 ],
  44011. "O": [ 1835 ]
  44012. }
  44013. },
  44014. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10": {
  44015. "hide_name": 0,
  44016. "type": "SB_LUT4",
  44017. "parameters": {
  44018. "LUT_INIT": "1111100011111111"
  44019. },
  44020. "attributes": {
  44021. "module_not_derived": "00000000000000000000000000000001",
  44022. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44023. },
  44024. "port_directions": {
  44025. "I0": "input",
  44026. "I1": "input",
  44027. "I2": "input",
  44028. "I3": "input",
  44029. "O": "output"
  44030. },
  44031. "connections": {
  44032. "I0": [ 1849 ],
  44033. "I1": [ 1367 ],
  44034. "I2": [ 1850 ],
  44035. "I3": [ 1851 ],
  44036. "O": [ 1844 ]
  44037. }
  44038. },
  44039. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O": {
  44040. "hide_name": 0,
  44041. "type": "SB_LUT4",
  44042. "parameters": {
  44043. "LUT_INIT": "0011000011110000"
  44044. },
  44045. "attributes": {
  44046. "module_not_derived": "00000000000000000000000000000001",
  44047. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44048. },
  44049. "port_directions": {
  44050. "I0": "input",
  44051. "I1": "input",
  44052. "I2": "input",
  44053. "I3": "input",
  44054. "O": "output"
  44055. },
  44056. "connections": {
  44057. "I0": [ "0" ],
  44058. "I1": [ 1852 ],
  44059. "I2": [ 1853 ],
  44060. "I3": [ 1375 ],
  44061. "O": [ 1851 ]
  44062. }
  44063. },
  44064. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_1": {
  44065. "hide_name": 0,
  44066. "type": "SB_LUT4",
  44067. "parameters": {
  44068. "LUT_INIT": "1011100000000000"
  44069. },
  44070. "attributes": {
  44071. "module_not_derived": "00000000000000000000000000000001",
  44072. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44073. },
  44074. "port_directions": {
  44075. "I0": "input",
  44076. "I1": "input",
  44077. "I2": "input",
  44078. "I3": "input",
  44079. "O": "output"
  44080. },
  44081. "connections": {
  44082. "I0": [ 1487 ],
  44083. "I1": [ 1378 ],
  44084. "I2": [ 1854 ],
  44085. "I3": [ 1380 ],
  44086. "O": [ 1850 ]
  44087. }
  44088. },
  44089. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44090. "hide_name": 0,
  44091. "type": "SB_LUT4",
  44092. "parameters": {
  44093. "LUT_INIT": "0110100110010110"
  44094. },
  44095. "attributes": {
  44096. "module_not_derived": "00000000000000000000000000000001",
  44097. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44098. },
  44099. "port_directions": {
  44100. "I0": "input",
  44101. "I1": "input",
  44102. "I2": "input",
  44103. "I3": "input",
  44104. "O": "output"
  44105. },
  44106. "connections": {
  44107. "I0": [ "0" ],
  44108. "I1": [ "0" ],
  44109. "I2": [ 1486 ],
  44110. "I3": [ 1855 ],
  44111. "O": [ 1854 ]
  44112. }
  44113. },
  44114. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44115. "hide_name": 0,
  44116. "type": "SB_CARRY",
  44117. "parameters": {
  44118. },
  44119. "attributes": {
  44120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44121. },
  44122. "port_directions": {
  44123. "CI": "input",
  44124. "CO": "output",
  44125. "I0": "input",
  44126. "I1": "input"
  44127. },
  44128. "connections": {
  44129. "CI": [ 1856 ],
  44130. "CO": [ 1855 ],
  44131. "I0": [ "0" ],
  44132. "I1": [ 1488 ]
  44133. }
  44134. },
  44135. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  44136. "hide_name": 0,
  44137. "type": "SB_LUT4",
  44138. "parameters": {
  44139. "LUT_INIT": "0011111100110101"
  44140. },
  44141. "attributes": {
  44142. "module_not_derived": "00000000000000000000000000000001",
  44143. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44144. },
  44145. "port_directions": {
  44146. "I0": "input",
  44147. "I1": "input",
  44148. "I2": "input",
  44149. "I3": "input",
  44150. "O": "output"
  44151. },
  44152. "connections": {
  44153. "I0": [ 1188 ],
  44154. "I1": [ 1068 ],
  44155. "I2": [ 1050 ],
  44156. "I3": [ 1052 ],
  44157. "O": [ 1853 ]
  44158. }
  44159. },
  44160. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11": {
  44161. "hide_name": 0,
  44162. "type": "SB_LUT4",
  44163. "parameters": {
  44164. "LUT_INIT": "1111100011111111"
  44165. },
  44166. "attributes": {
  44167. "module_not_derived": "00000000000000000000000000000001",
  44168. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44169. },
  44170. "port_directions": {
  44171. "I0": "input",
  44172. "I1": "input",
  44173. "I2": "input",
  44174. "I3": "input",
  44175. "O": "output"
  44176. },
  44177. "connections": {
  44178. "I0": [ 1857 ],
  44179. "I1": [ 1367 ],
  44180. "I2": [ 1858 ],
  44181. "I3": [ 1859 ],
  44182. "O": [ 1843 ]
  44183. }
  44184. },
  44185. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O": {
  44186. "hide_name": 0,
  44187. "type": "SB_LUT4",
  44188. "parameters": {
  44189. "LUT_INIT": "0011000011110000"
  44190. },
  44191. "attributes": {
  44192. "module_not_derived": "00000000000000000000000000000001",
  44193. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44194. },
  44195. "port_directions": {
  44196. "I0": "input",
  44197. "I1": "input",
  44198. "I2": "input",
  44199. "I3": "input",
  44200. "O": "output"
  44201. },
  44202. "connections": {
  44203. "I0": [ "0" ],
  44204. "I1": [ 1860 ],
  44205. "I2": [ 1861 ],
  44206. "I3": [ 1375 ],
  44207. "O": [ 1859 ]
  44208. }
  44209. },
  44210. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_1": {
  44211. "hide_name": 0,
  44212. "type": "SB_LUT4",
  44213. "parameters": {
  44214. "LUT_INIT": "1011100000000000"
  44215. },
  44216. "attributes": {
  44217. "module_not_derived": "00000000000000000000000000000001",
  44218. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44219. },
  44220. "port_directions": {
  44221. "I0": "input",
  44222. "I1": "input",
  44223. "I2": "input",
  44224. "I3": "input",
  44225. "O": "output"
  44226. },
  44227. "connections": {
  44228. "I0": [ 1523 ],
  44229. "I1": [ 1378 ],
  44230. "I2": [ 1862 ],
  44231. "I3": [ 1380 ],
  44232. "O": [ 1858 ]
  44233. }
  44234. },
  44235. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44236. "hide_name": 0,
  44237. "type": "SB_LUT4",
  44238. "parameters": {
  44239. "LUT_INIT": "0110100110010110"
  44240. },
  44241. "attributes": {
  44242. "module_not_derived": "00000000000000000000000000000001",
  44243. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44244. },
  44245. "port_directions": {
  44246. "I0": "input",
  44247. "I1": "input",
  44248. "I2": "input",
  44249. "I3": "input",
  44250. "O": "output"
  44251. },
  44252. "connections": {
  44253. "I0": [ "0" ],
  44254. "I1": [ "0" ],
  44255. "I2": [ 1522 ],
  44256. "I3": [ 1863 ],
  44257. "O": [ 1862 ]
  44258. }
  44259. },
  44260. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44261. "hide_name": 0,
  44262. "type": "SB_CARRY",
  44263. "parameters": {
  44264. },
  44265. "attributes": {
  44266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44267. },
  44268. "port_directions": {
  44269. "CI": "input",
  44270. "CO": "output",
  44271. "I0": "input",
  44272. "I1": "input"
  44273. },
  44274. "connections": {
  44275. "CI": [ 1855 ],
  44276. "CO": [ 1863 ],
  44277. "I0": [ "0" ],
  44278. "I1": [ 1486 ]
  44279. }
  44280. },
  44281. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  44282. "hide_name": 0,
  44283. "type": "SB_LUT4",
  44284. "parameters": {
  44285. "LUT_INIT": "0011111100110101"
  44286. },
  44287. "attributes": {
  44288. "module_not_derived": "00000000000000000000000000000001",
  44289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44290. },
  44291. "port_directions": {
  44292. "I0": "input",
  44293. "I1": "input",
  44294. "I2": "input",
  44295. "I3": "input",
  44296. "O": "output"
  44297. },
  44298. "connections": {
  44299. "I0": [ 1238 ],
  44300. "I1": [ 1125 ],
  44301. "I2": [ 1050 ],
  44302. "I3": [ 1052 ],
  44303. "O": [ 1861 ]
  44304. }
  44305. },
  44306. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12": {
  44307. "hide_name": 0,
  44308. "type": "SB_LUT4",
  44309. "parameters": {
  44310. "LUT_INIT": "1111100011111111"
  44311. },
  44312. "attributes": {
  44313. "module_not_derived": "00000000000000000000000000000001",
  44314. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44315. },
  44316. "port_directions": {
  44317. "I0": "input",
  44318. "I1": "input",
  44319. "I2": "input",
  44320. "I3": "input",
  44321. "O": "output"
  44322. },
  44323. "connections": {
  44324. "I0": [ 1864 ],
  44325. "I1": [ 1367 ],
  44326. "I2": [ 1865 ],
  44327. "I3": [ 1866 ],
  44328. "O": [ 1842 ]
  44329. }
  44330. },
  44331. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O": {
  44332. "hide_name": 0,
  44333. "type": "SB_LUT4",
  44334. "parameters": {
  44335. "LUT_INIT": "0011000011110000"
  44336. },
  44337. "attributes": {
  44338. "module_not_derived": "00000000000000000000000000000001",
  44339. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44340. },
  44341. "port_directions": {
  44342. "I0": "input",
  44343. "I1": "input",
  44344. "I2": "input",
  44345. "I3": "input",
  44346. "O": "output"
  44347. },
  44348. "connections": {
  44349. "I0": [ "0" ],
  44350. "I1": [ 1867 ],
  44351. "I2": [ 1868 ],
  44352. "I3": [ 1375 ],
  44353. "O": [ 1866 ]
  44354. }
  44355. },
  44356. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_1": {
  44357. "hide_name": 0,
  44358. "type": "SB_LUT4",
  44359. "parameters": {
  44360. "LUT_INIT": "1011100000000000"
  44361. },
  44362. "attributes": {
  44363. "module_not_derived": "00000000000000000000000000000001",
  44364. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44365. },
  44366. "port_directions": {
  44367. "I0": "input",
  44368. "I1": "input",
  44369. "I2": "input",
  44370. "I3": "input",
  44371. "O": "output"
  44372. },
  44373. "connections": {
  44374. "I0": [ 1521 ],
  44375. "I1": [ 1378 ],
  44376. "I2": [ 1869 ],
  44377. "I3": [ 1380 ],
  44378. "O": [ 1865 ]
  44379. }
  44380. },
  44381. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44382. "hide_name": 0,
  44383. "type": "SB_LUT4",
  44384. "parameters": {
  44385. "LUT_INIT": "0110100110010110"
  44386. },
  44387. "attributes": {
  44388. "module_not_derived": "00000000000000000000000000000001",
  44389. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44390. },
  44391. "port_directions": {
  44392. "I0": "input",
  44393. "I1": "input",
  44394. "I2": "input",
  44395. "I3": "input",
  44396. "O": "output"
  44397. },
  44398. "connections": {
  44399. "I0": [ "0" ],
  44400. "I1": [ "0" ],
  44401. "I2": [ 1520 ],
  44402. "I3": [ 1870 ],
  44403. "O": [ 1869 ]
  44404. }
  44405. },
  44406. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44407. "hide_name": 0,
  44408. "type": "SB_CARRY",
  44409. "parameters": {
  44410. },
  44411. "attributes": {
  44412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44413. },
  44414. "port_directions": {
  44415. "CI": "input",
  44416. "CO": "output",
  44417. "I0": "input",
  44418. "I1": "input"
  44419. },
  44420. "connections": {
  44421. "CI": [ 1863 ],
  44422. "CO": [ 1870 ],
  44423. "I0": [ "0" ],
  44424. "I1": [ 1522 ]
  44425. }
  44426. },
  44427. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  44428. "hide_name": 0,
  44429. "type": "SB_LUT4",
  44430. "parameters": {
  44431. "LUT_INIT": "0011111100110101"
  44432. },
  44433. "attributes": {
  44434. "module_not_derived": "00000000000000000000000000000001",
  44435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44436. },
  44437. "port_directions": {
  44438. "I0": "input",
  44439. "I1": "input",
  44440. "I2": "input",
  44441. "I3": "input",
  44442. "O": "output"
  44443. },
  44444. "connections": {
  44445. "I0": [ 1236 ],
  44446. "I1": [ 1123 ],
  44447. "I2": [ 1050 ],
  44448. "I3": [ 1052 ],
  44449. "O": [ 1868 ]
  44450. }
  44451. },
  44452. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13": {
  44453. "hide_name": 0,
  44454. "type": "SB_LUT4",
  44455. "parameters": {
  44456. "LUT_INIT": "1111100011111111"
  44457. },
  44458. "attributes": {
  44459. "module_not_derived": "00000000000000000000000000000001",
  44460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44461. },
  44462. "port_directions": {
  44463. "I0": "input",
  44464. "I1": "input",
  44465. "I2": "input",
  44466. "I3": "input",
  44467. "O": "output"
  44468. },
  44469. "connections": {
  44470. "I0": [ 1871 ],
  44471. "I1": [ 1367 ],
  44472. "I2": [ 1872 ],
  44473. "I3": [ 1873 ],
  44474. "O": [ 1841 ]
  44475. }
  44476. },
  44477. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O": {
  44478. "hide_name": 0,
  44479. "type": "SB_LUT4",
  44480. "parameters": {
  44481. "LUT_INIT": "0011000011110000"
  44482. },
  44483. "attributes": {
  44484. "module_not_derived": "00000000000000000000000000000001",
  44485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44486. },
  44487. "port_directions": {
  44488. "I0": "input",
  44489. "I1": "input",
  44490. "I2": "input",
  44491. "I3": "input",
  44492. "O": "output"
  44493. },
  44494. "connections": {
  44495. "I0": [ "0" ],
  44496. "I1": [ 1874 ],
  44497. "I2": [ 1875 ],
  44498. "I3": [ 1375 ],
  44499. "O": [ 1873 ]
  44500. }
  44501. },
  44502. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_1": {
  44503. "hide_name": 0,
  44504. "type": "SB_LUT4",
  44505. "parameters": {
  44506. "LUT_INIT": "1011100000000000"
  44507. },
  44508. "attributes": {
  44509. "module_not_derived": "00000000000000000000000000000001",
  44510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44511. },
  44512. "port_directions": {
  44513. "I0": "input",
  44514. "I1": "input",
  44515. "I2": "input",
  44516. "I3": "input",
  44517. "O": "output"
  44518. },
  44519. "connections": {
  44520. "I0": [ 1519 ],
  44521. "I1": [ 1378 ],
  44522. "I2": [ 1876 ],
  44523. "I3": [ 1380 ],
  44524. "O": [ 1872 ]
  44525. }
  44526. },
  44527. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44528. "hide_name": 0,
  44529. "type": "SB_LUT4",
  44530. "parameters": {
  44531. "LUT_INIT": "0110100110010110"
  44532. },
  44533. "attributes": {
  44534. "module_not_derived": "00000000000000000000000000000001",
  44535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44536. },
  44537. "port_directions": {
  44538. "I0": "input",
  44539. "I1": "input",
  44540. "I2": "input",
  44541. "I3": "input",
  44542. "O": "output"
  44543. },
  44544. "connections": {
  44545. "I0": [ "0" ],
  44546. "I1": [ "0" ],
  44547. "I2": [ 1518 ],
  44548. "I3": [ 1877 ],
  44549. "O": [ 1876 ]
  44550. }
  44551. },
  44552. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44553. "hide_name": 0,
  44554. "type": "SB_CARRY",
  44555. "parameters": {
  44556. },
  44557. "attributes": {
  44558. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44559. },
  44560. "port_directions": {
  44561. "CI": "input",
  44562. "CO": "output",
  44563. "I0": "input",
  44564. "I1": "input"
  44565. },
  44566. "connections": {
  44567. "CI": [ 1870 ],
  44568. "CO": [ 1877 ],
  44569. "I0": [ "0" ],
  44570. "I1": [ 1520 ]
  44571. }
  44572. },
  44573. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  44574. "hide_name": 0,
  44575. "type": "SB_LUT4",
  44576. "parameters": {
  44577. "LUT_INIT": "0011111100110101"
  44578. },
  44579. "attributes": {
  44580. "module_not_derived": "00000000000000000000000000000001",
  44581. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44582. },
  44583. "port_directions": {
  44584. "I0": "input",
  44585. "I1": "input",
  44586. "I2": "input",
  44587. "I3": "input",
  44588. "O": "output"
  44589. },
  44590. "connections": {
  44591. "I0": [ 1234 ],
  44592. "I1": [ 1121 ],
  44593. "I2": [ 1050 ],
  44594. "I3": [ 1052 ],
  44595. "O": [ 1875 ]
  44596. }
  44597. },
  44598. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14": {
  44599. "hide_name": 0,
  44600. "type": "SB_LUT4",
  44601. "parameters": {
  44602. "LUT_INIT": "1111100011111111"
  44603. },
  44604. "attributes": {
  44605. "module_not_derived": "00000000000000000000000000000001",
  44606. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44607. },
  44608. "port_directions": {
  44609. "I0": "input",
  44610. "I1": "input",
  44611. "I2": "input",
  44612. "I3": "input",
  44613. "O": "output"
  44614. },
  44615. "connections": {
  44616. "I0": [ 1878 ],
  44617. "I1": [ 1367 ],
  44618. "I2": [ 1879 ],
  44619. "I3": [ 1880 ],
  44620. "O": [ 1840 ]
  44621. }
  44622. },
  44623. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O": {
  44624. "hide_name": 0,
  44625. "type": "SB_LUT4",
  44626. "parameters": {
  44627. "LUT_INIT": "0011000011110000"
  44628. },
  44629. "attributes": {
  44630. "module_not_derived": "00000000000000000000000000000001",
  44631. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44632. },
  44633. "port_directions": {
  44634. "I0": "input",
  44635. "I1": "input",
  44636. "I2": "input",
  44637. "I3": "input",
  44638. "O": "output"
  44639. },
  44640. "connections": {
  44641. "I0": [ "0" ],
  44642. "I1": [ 1881 ],
  44643. "I2": [ 1882 ],
  44644. "I3": [ 1375 ],
  44645. "O": [ 1880 ]
  44646. }
  44647. },
  44648. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_1": {
  44649. "hide_name": 0,
  44650. "type": "SB_LUT4",
  44651. "parameters": {
  44652. "LUT_INIT": "1011100000000000"
  44653. },
  44654. "attributes": {
  44655. "module_not_derived": "00000000000000000000000000000001",
  44656. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44657. },
  44658. "port_directions": {
  44659. "I0": "input",
  44660. "I1": "input",
  44661. "I2": "input",
  44662. "I3": "input",
  44663. "O": "output"
  44664. },
  44665. "connections": {
  44666. "I0": [ 1517 ],
  44667. "I1": [ 1378 ],
  44668. "I2": [ 1883 ],
  44669. "I3": [ 1380 ],
  44670. "O": [ 1879 ]
  44671. }
  44672. },
  44673. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44674. "hide_name": 0,
  44675. "type": "SB_LUT4",
  44676. "parameters": {
  44677. "LUT_INIT": "0110100110010110"
  44678. },
  44679. "attributes": {
  44680. "module_not_derived": "00000000000000000000000000000001",
  44681. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44682. },
  44683. "port_directions": {
  44684. "I0": "input",
  44685. "I1": "input",
  44686. "I2": "input",
  44687. "I3": "input",
  44688. "O": "output"
  44689. },
  44690. "connections": {
  44691. "I0": [ "0" ],
  44692. "I1": [ "0" ],
  44693. "I2": [ 1516 ],
  44694. "I3": [ 1884 ],
  44695. "O": [ 1883 ]
  44696. }
  44697. },
  44698. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44699. "hide_name": 0,
  44700. "type": "SB_CARRY",
  44701. "parameters": {
  44702. },
  44703. "attributes": {
  44704. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44705. },
  44706. "port_directions": {
  44707. "CI": "input",
  44708. "CO": "output",
  44709. "I0": "input",
  44710. "I1": "input"
  44711. },
  44712. "connections": {
  44713. "CI": [ 1877 ],
  44714. "CO": [ 1884 ],
  44715. "I0": [ "0" ],
  44716. "I1": [ 1518 ]
  44717. }
  44718. },
  44719. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  44720. "hide_name": 0,
  44721. "type": "SB_LUT4",
  44722. "parameters": {
  44723. "LUT_INIT": "0011111100110101"
  44724. },
  44725. "attributes": {
  44726. "module_not_derived": "00000000000000000000000000000001",
  44727. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44728. },
  44729. "port_directions": {
  44730. "I0": "input",
  44731. "I1": "input",
  44732. "I2": "input",
  44733. "I3": "input",
  44734. "O": "output"
  44735. },
  44736. "connections": {
  44737. "I0": [ 1232 ],
  44738. "I1": [ 1119 ],
  44739. "I2": [ 1050 ],
  44740. "I3": [ 1052 ],
  44741. "O": [ 1882 ]
  44742. }
  44743. },
  44744. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15": {
  44745. "hide_name": 0,
  44746. "type": "SB_LUT4",
  44747. "parameters": {
  44748. "LUT_INIT": "1111100011111111"
  44749. },
  44750. "attributes": {
  44751. "module_not_derived": "00000000000000000000000000000001",
  44752. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44753. },
  44754. "port_directions": {
  44755. "I0": "input",
  44756. "I1": "input",
  44757. "I2": "input",
  44758. "I3": "input",
  44759. "O": "output"
  44760. },
  44761. "connections": {
  44762. "I0": [ 1367 ],
  44763. "I1": [ 1885 ],
  44764. "I2": [ 1886 ],
  44765. "I3": [ 1887 ],
  44766. "O": [ 1839 ]
  44767. }
  44768. },
  44769. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O": {
  44770. "hide_name": 0,
  44771. "type": "SB_LUT4",
  44772. "parameters": {
  44773. "LUT_INIT": "0011000011110000"
  44774. },
  44775. "attributes": {
  44776. "module_not_derived": "00000000000000000000000000000001",
  44777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44778. },
  44779. "port_directions": {
  44780. "I0": "input",
  44781. "I1": "input",
  44782. "I2": "input",
  44783. "I3": "input",
  44784. "O": "output"
  44785. },
  44786. "connections": {
  44787. "I0": [ "0" ],
  44788. "I1": [ 1888 ],
  44789. "I2": [ 1889 ],
  44790. "I3": [ 1375 ],
  44791. "O": [ 1887 ]
  44792. }
  44793. },
  44794. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_1": {
  44795. "hide_name": 0,
  44796. "type": "SB_LUT4",
  44797. "parameters": {
  44798. "LUT_INIT": "1011100000000000"
  44799. },
  44800. "attributes": {
  44801. "module_not_derived": "00000000000000000000000000000001",
  44802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44803. },
  44804. "port_directions": {
  44805. "I0": "input",
  44806. "I1": "input",
  44807. "I2": "input",
  44808. "I3": "input",
  44809. "O": "output"
  44810. },
  44811. "connections": {
  44812. "I0": [ 1515 ],
  44813. "I1": [ 1378 ],
  44814. "I2": [ 1890 ],
  44815. "I3": [ 1380 ],
  44816. "O": [ 1886 ]
  44817. }
  44818. },
  44819. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44820. "hide_name": 0,
  44821. "type": "SB_LUT4",
  44822. "parameters": {
  44823. "LUT_INIT": "0110100110010110"
  44824. },
  44825. "attributes": {
  44826. "module_not_derived": "00000000000000000000000000000001",
  44827. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44828. },
  44829. "port_directions": {
  44830. "I0": "input",
  44831. "I1": "input",
  44832. "I2": "input",
  44833. "I3": "input",
  44834. "O": "output"
  44835. },
  44836. "connections": {
  44837. "I0": [ "0" ],
  44838. "I1": [ "0" ],
  44839. "I2": [ 1514 ],
  44840. "I3": [ 1891 ],
  44841. "O": [ 1890 ]
  44842. }
  44843. },
  44844. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44845. "hide_name": 0,
  44846. "type": "SB_CARRY",
  44847. "parameters": {
  44848. },
  44849. "attributes": {
  44850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44851. },
  44852. "port_directions": {
  44853. "CI": "input",
  44854. "CO": "output",
  44855. "I0": "input",
  44856. "I1": "input"
  44857. },
  44858. "connections": {
  44859. "CI": [ 1884 ],
  44860. "CO": [ 1891 ],
  44861. "I0": [ "0" ],
  44862. "I1": [ 1516 ]
  44863. }
  44864. },
  44865. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  44866. "hide_name": 0,
  44867. "type": "SB_LUT4",
  44868. "parameters": {
  44869. "LUT_INIT": "0011111100110101"
  44870. },
  44871. "attributes": {
  44872. "module_not_derived": "00000000000000000000000000000001",
  44873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44874. },
  44875. "port_directions": {
  44876. "I0": "input",
  44877. "I1": "input",
  44878. "I2": "input",
  44879. "I3": "input",
  44880. "O": "output"
  44881. },
  44882. "connections": {
  44883. "I0": [ 1230 ],
  44884. "I1": [ 1117 ],
  44885. "I2": [ 1050 ],
  44886. "I3": [ 1052 ],
  44887. "O": [ 1889 ]
  44888. }
  44889. },
  44890. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16": {
  44891. "hide_name": 0,
  44892. "type": "SB_LUT4",
  44893. "parameters": {
  44894. "LUT_INIT": "1110110011111111"
  44895. },
  44896. "attributes": {
  44897. "module_not_derived": "00000000000000000000000000000001",
  44898. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44899. },
  44900. "port_directions": {
  44901. "I0": "input",
  44902. "I1": "input",
  44903. "I2": "input",
  44904. "I3": "input",
  44905. "O": "output"
  44906. },
  44907. "connections": {
  44908. "I0": [ 1367 ],
  44909. "I1": [ 1892 ],
  44910. "I2": [ 1893 ],
  44911. "I3": [ 1894 ],
  44912. "O": [ 1838 ]
  44913. }
  44914. },
  44915. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O": {
  44916. "hide_name": 0,
  44917. "type": "SB_LUT4",
  44918. "parameters": {
  44919. "LUT_INIT": "0011000011110000"
  44920. },
  44921. "attributes": {
  44922. "module_not_derived": "00000000000000000000000000000001",
  44923. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  44924. },
  44925. "port_directions": {
  44926. "I0": "input",
  44927. "I1": "input",
  44928. "I2": "input",
  44929. "I3": "input",
  44930. "O": "output"
  44931. },
  44932. "connections": {
  44933. "I0": [ "0" ],
  44934. "I1": [ 1895 ],
  44935. "I2": [ 1896 ],
  44936. "I3": [ 1375 ],
  44937. "O": [ 1894 ]
  44938. }
  44939. },
  44940. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_1": {
  44941. "hide_name": 0,
  44942. "type": "SB_LUT4",
  44943. "parameters": {
  44944. "LUT_INIT": "1011100000000000"
  44945. },
  44946. "attributes": {
  44947. "module_not_derived": "00000000000000000000000000000001",
  44948. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44949. },
  44950. "port_directions": {
  44951. "I0": "input",
  44952. "I1": "input",
  44953. "I2": "input",
  44954. "I3": "input",
  44955. "O": "output"
  44956. },
  44957. "connections": {
  44958. "I0": [ 1513 ],
  44959. "I1": [ 1378 ],
  44960. "I2": [ 1897 ],
  44961. "I3": [ 1380 ],
  44962. "O": [ 1892 ]
  44963. }
  44964. },
  44965. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_1_I2_SB_LUT4_O": {
  44966. "hide_name": 0,
  44967. "type": "SB_LUT4",
  44968. "parameters": {
  44969. "LUT_INIT": "0110100110010110"
  44970. },
  44971. "attributes": {
  44972. "module_not_derived": "00000000000000000000000000000001",
  44973. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  44974. },
  44975. "port_directions": {
  44976. "I0": "input",
  44977. "I1": "input",
  44978. "I2": "input",
  44979. "I3": "input",
  44980. "O": "output"
  44981. },
  44982. "connections": {
  44983. "I0": [ "0" ],
  44984. "I1": [ "0" ],
  44985. "I2": [ 1512 ],
  44986. "I3": [ 1898 ],
  44987. "O": [ 1897 ]
  44988. }
  44989. },
  44990. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  44991. "hide_name": 0,
  44992. "type": "SB_CARRY",
  44993. "parameters": {
  44994. },
  44995. "attributes": {
  44996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  44997. },
  44998. "port_directions": {
  44999. "CI": "input",
  45000. "CO": "output",
  45001. "I0": "input",
  45002. "I1": "input"
  45003. },
  45004. "connections": {
  45005. "CI": [ 1891 ],
  45006. "CO": [ 1898 ],
  45007. "I0": [ "0" ],
  45008. "I1": [ 1514 ]
  45009. }
  45010. },
  45011. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  45012. "hide_name": 0,
  45013. "type": "SB_LUT4",
  45014. "parameters": {
  45015. "LUT_INIT": "0011111100110101"
  45016. },
  45017. "attributes": {
  45018. "module_not_derived": "00000000000000000000000000000001",
  45019. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45020. },
  45021. "port_directions": {
  45022. "I0": "input",
  45023. "I1": "input",
  45024. "I2": "input",
  45025. "I3": "input",
  45026. "O": "output"
  45027. },
  45028. "connections": {
  45029. "I0": [ 1228 ],
  45030. "I1": [ 1115 ],
  45031. "I2": [ 1050 ],
  45032. "I3": [ 1052 ],
  45033. "O": [ 1896 ]
  45034. }
  45035. },
  45036. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17": {
  45037. "hide_name": 0,
  45038. "type": "SB_LUT4",
  45039. "parameters": {
  45040. "LUT_INIT": "1110110011111111"
  45041. },
  45042. "attributes": {
  45043. "module_not_derived": "00000000000000000000000000000001",
  45044. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45045. },
  45046. "port_directions": {
  45047. "I0": "input",
  45048. "I1": "input",
  45049. "I2": "input",
  45050. "I3": "input",
  45051. "O": "output"
  45052. },
  45053. "connections": {
  45054. "I0": [ 1367 ],
  45055. "I1": [ 1899 ],
  45056. "I2": [ 1900 ],
  45057. "I3": [ 1901 ],
  45058. "O": [ 1837 ]
  45059. }
  45060. },
  45061. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O": {
  45062. "hide_name": 0,
  45063. "type": "SB_LUT4",
  45064. "parameters": {
  45065. "LUT_INIT": "0011000011110000"
  45066. },
  45067. "attributes": {
  45068. "module_not_derived": "00000000000000000000000000000001",
  45069. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45070. },
  45071. "port_directions": {
  45072. "I0": "input",
  45073. "I1": "input",
  45074. "I2": "input",
  45075. "I3": "input",
  45076. "O": "output"
  45077. },
  45078. "connections": {
  45079. "I0": [ "0" ],
  45080. "I1": [ 1902 ],
  45081. "I2": [ 1903 ],
  45082. "I3": [ 1375 ],
  45083. "O": [ 1901 ]
  45084. }
  45085. },
  45086. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_1": {
  45087. "hide_name": 0,
  45088. "type": "SB_LUT4",
  45089. "parameters": {
  45090. "LUT_INIT": "1011100000000000"
  45091. },
  45092. "attributes": {
  45093. "module_not_derived": "00000000000000000000000000000001",
  45094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45095. },
  45096. "port_directions": {
  45097. "I0": "input",
  45098. "I1": "input",
  45099. "I2": "input",
  45100. "I3": "input",
  45101. "O": "output"
  45102. },
  45103. "connections": {
  45104. "I0": [ 1511 ],
  45105. "I1": [ 1378 ],
  45106. "I2": [ 1904 ],
  45107. "I3": [ 1380 ],
  45108. "O": [ 1899 ]
  45109. }
  45110. },
  45111. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_1_I2_SB_LUT4_O": {
  45112. "hide_name": 0,
  45113. "type": "SB_LUT4",
  45114. "parameters": {
  45115. "LUT_INIT": "0110100110010110"
  45116. },
  45117. "attributes": {
  45118. "module_not_derived": "00000000000000000000000000000001",
  45119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45120. },
  45121. "port_directions": {
  45122. "I0": "input",
  45123. "I1": "input",
  45124. "I2": "input",
  45125. "I3": "input",
  45126. "O": "output"
  45127. },
  45128. "connections": {
  45129. "I0": [ "0" ],
  45130. "I1": [ "0" ],
  45131. "I2": [ 1510 ],
  45132. "I3": [ 1905 ],
  45133. "O": [ 1904 ]
  45134. }
  45135. },
  45136. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  45137. "hide_name": 0,
  45138. "type": "SB_CARRY",
  45139. "parameters": {
  45140. },
  45141. "attributes": {
  45142. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45143. },
  45144. "port_directions": {
  45145. "CI": "input",
  45146. "CO": "output",
  45147. "I0": "input",
  45148. "I1": "input"
  45149. },
  45150. "connections": {
  45151. "CI": [ 1898 ],
  45152. "CO": [ 1905 ],
  45153. "I0": [ "0" ],
  45154. "I1": [ 1512 ]
  45155. }
  45156. },
  45157. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  45158. "hide_name": 0,
  45159. "type": "SB_LUT4",
  45160. "parameters": {
  45161. "LUT_INIT": "0011111100110101"
  45162. },
  45163. "attributes": {
  45164. "module_not_derived": "00000000000000000000000000000001",
  45165. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45166. },
  45167. "port_directions": {
  45168. "I0": "input",
  45169. "I1": "input",
  45170. "I2": "input",
  45171. "I3": "input",
  45172. "O": "output"
  45173. },
  45174. "connections": {
  45175. "I0": [ 1226 ],
  45176. "I1": [ 1109 ],
  45177. "I2": [ 1050 ],
  45178. "I3": [ 1052 ],
  45179. "O": [ 1903 ]
  45180. }
  45181. },
  45182. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18": {
  45183. "hide_name": 0,
  45184. "type": "SB_LUT4",
  45185. "parameters": {
  45186. "LUT_INIT": "1110110011111111"
  45187. },
  45188. "attributes": {
  45189. "module_not_derived": "00000000000000000000000000000001",
  45190. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45191. },
  45192. "port_directions": {
  45193. "I0": "input",
  45194. "I1": "input",
  45195. "I2": "input",
  45196. "I3": "input",
  45197. "O": "output"
  45198. },
  45199. "connections": {
  45200. "I0": [ 1367 ],
  45201. "I1": [ 1906 ],
  45202. "I2": [ 1907 ],
  45203. "I3": [ 1908 ],
  45204. "O": [ 1826 ]
  45205. }
  45206. },
  45207. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O": {
  45208. "hide_name": 0,
  45209. "type": "SB_LUT4",
  45210. "parameters": {
  45211. "LUT_INIT": "0011000011110000"
  45212. },
  45213. "attributes": {
  45214. "module_not_derived": "00000000000000000000000000000001",
  45215. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45216. },
  45217. "port_directions": {
  45218. "I0": "input",
  45219. "I1": "input",
  45220. "I2": "input",
  45221. "I3": "input",
  45222. "O": "output"
  45223. },
  45224. "connections": {
  45225. "I0": [ "0" ],
  45226. "I1": [ 1909 ],
  45227. "I2": [ 1910 ],
  45228. "I3": [ 1375 ],
  45229. "O": [ 1908 ]
  45230. }
  45231. },
  45232. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_1": {
  45233. "hide_name": 0,
  45234. "type": "SB_LUT4",
  45235. "parameters": {
  45236. "LUT_INIT": "1011000010000000"
  45237. },
  45238. "attributes": {
  45239. "module_not_derived": "00000000000000000000000000000001",
  45240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45241. },
  45242. "port_directions": {
  45243. "I0": "input",
  45244. "I1": "input",
  45245. "I2": "input",
  45246. "I3": "input",
  45247. "O": "output"
  45248. },
  45249. "connections": {
  45250. "I0": [ 1507 ],
  45251. "I1": [ 1378 ],
  45252. "I2": [ 1380 ],
  45253. "I3": [ 1911 ],
  45254. "O": [ 1906 ]
  45255. }
  45256. },
  45257. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  45258. "hide_name": 0,
  45259. "type": "SB_LUT4",
  45260. "parameters": {
  45261. "LUT_INIT": "0110100110010110"
  45262. },
  45263. "attributes": {
  45264. "module_not_derived": "00000000000000000000000000000001",
  45265. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45266. },
  45267. "port_directions": {
  45268. "I0": "input",
  45269. "I1": "input",
  45270. "I2": "input",
  45271. "I3": "input",
  45272. "O": "output"
  45273. },
  45274. "connections": {
  45275. "I0": [ "0" ],
  45276. "I1": [ "0" ],
  45277. "I2": [ 1506 ],
  45278. "I3": [ 1912 ],
  45279. "O": [ 1911 ]
  45280. }
  45281. },
  45282. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  45283. "hide_name": 0,
  45284. "type": "SB_CARRY",
  45285. "parameters": {
  45286. },
  45287. "attributes": {
  45288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45289. },
  45290. "port_directions": {
  45291. "CI": "input",
  45292. "CO": "output",
  45293. "I0": "input",
  45294. "I1": "input"
  45295. },
  45296. "connections": {
  45297. "CI": [ 1905 ],
  45298. "CO": [ 1912 ],
  45299. "I0": [ "0" ],
  45300. "I1": [ 1510 ]
  45301. }
  45302. },
  45303. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  45304. "hide_name": 0,
  45305. "type": "SB_LUT4",
  45306. "parameters": {
  45307. "LUT_INIT": "0011111100110101"
  45308. },
  45309. "attributes": {
  45310. "module_not_derived": "00000000000000000000000000000001",
  45311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45312. },
  45313. "port_directions": {
  45314. "I0": "input",
  45315. "I1": "input",
  45316. "I2": "input",
  45317. "I3": "input",
  45318. "O": "output"
  45319. },
  45320. "connections": {
  45321. "I0": [ 1207 ],
  45322. "I1": [ 1088 ],
  45323. "I2": [ 1050 ],
  45324. "I3": [ 1052 ],
  45325. "O": [ 1910 ]
  45326. }
  45327. },
  45328. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19": {
  45329. "hide_name": 0,
  45330. "type": "SB_LUT4",
  45331. "parameters": {
  45332. "LUT_INIT": "1110111111001111"
  45333. },
  45334. "attributes": {
  45335. "module_not_derived": "00000000000000000000000000000001",
  45336. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45337. },
  45338. "port_directions": {
  45339. "I0": "input",
  45340. "I1": "input",
  45341. "I2": "input",
  45342. "I3": "input",
  45343. "O": "output"
  45344. },
  45345. "connections": {
  45346. "I0": [ 1367 ],
  45347. "I1": [ 1913 ],
  45348. "I2": [ 1914 ],
  45349. "I3": [ 1915 ],
  45350. "O": [ 1825 ]
  45351. }
  45352. },
  45353. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O": {
  45354. "hide_name": 0,
  45355. "type": "SB_LUT4",
  45356. "parameters": {
  45357. "LUT_INIT": "0011000011110000"
  45358. },
  45359. "attributes": {
  45360. "module_not_derived": "00000000000000000000000000000001",
  45361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45362. },
  45363. "port_directions": {
  45364. "I0": "input",
  45365. "I1": "input",
  45366. "I2": "input",
  45367. "I3": "input",
  45368. "O": "output"
  45369. },
  45370. "connections": {
  45371. "I0": [ "0" ],
  45372. "I1": [ 1916 ],
  45373. "I2": [ 1917 ],
  45374. "I3": [ 1375 ],
  45375. "O": [ 1914 ]
  45376. }
  45377. },
  45378. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_1": {
  45379. "hide_name": 0,
  45380. "type": "SB_LUT4",
  45381. "parameters": {
  45382. "LUT_INIT": "1011000010000000"
  45383. },
  45384. "attributes": {
  45385. "module_not_derived": "00000000000000000000000000000001",
  45386. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45387. },
  45388. "port_directions": {
  45389. "I0": "input",
  45390. "I1": "input",
  45391. "I2": "input",
  45392. "I3": "input",
  45393. "O": "output"
  45394. },
  45395. "connections": {
  45396. "I0": [ 1485 ],
  45397. "I1": [ 1378 ],
  45398. "I2": [ 1380 ],
  45399. "I3": [ 1918 ],
  45400. "O": [ 1913 ]
  45401. }
  45402. },
  45403. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  45404. "hide_name": 0,
  45405. "type": "SB_LUT4",
  45406. "parameters": {
  45407. "LUT_INIT": "0110100110010110"
  45408. },
  45409. "attributes": {
  45410. "module_not_derived": "00000000000000000000000000000001",
  45411. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45412. },
  45413. "port_directions": {
  45414. "I0": "input",
  45415. "I1": "input",
  45416. "I2": "input",
  45417. "I3": "input",
  45418. "O": "output"
  45419. },
  45420. "connections": {
  45421. "I0": [ "0" ],
  45422. "I1": [ "0" ],
  45423. "I2": [ 1484 ],
  45424. "I3": [ 1919 ],
  45425. "O": [ 1918 ]
  45426. }
  45427. },
  45428. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  45429. "hide_name": 0,
  45430. "type": "SB_CARRY",
  45431. "parameters": {
  45432. },
  45433. "attributes": {
  45434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45435. },
  45436. "port_directions": {
  45437. "CI": "input",
  45438. "CO": "output",
  45439. "I0": "input",
  45440. "I1": "input"
  45441. },
  45442. "connections": {
  45443. "CI": [ 1912 ],
  45444. "CO": [ 1919 ],
  45445. "I0": [ "0" ],
  45446. "I1": [ 1506 ]
  45447. }
  45448. },
  45449. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  45450. "hide_name": 0,
  45451. "type": "SB_LUT4",
  45452. "parameters": {
  45453. "LUT_INIT": "0011111100110101"
  45454. },
  45455. "attributes": {
  45456. "module_not_derived": "00000000000000000000000000000001",
  45457. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45458. },
  45459. "port_directions": {
  45460. "I0": "input",
  45461. "I1": "input",
  45462. "I2": "input",
  45463. "I3": "input",
  45464. "O": "output"
  45465. },
  45466. "connections": {
  45467. "I0": [ 1186 ],
  45468. "I1": [ 1066 ],
  45469. "I2": [ 1050 ],
  45470. "I3": [ 1052 ],
  45471. "O": [ 1917 ]
  45472. }
  45473. },
  45474. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O": {
  45475. "hide_name": 0,
  45476. "type": "SB_LUT4",
  45477. "parameters": {
  45478. "LUT_INIT": "0011000011110000"
  45479. },
  45480. "attributes": {
  45481. "module_not_derived": "00000000000000000000000000000001",
  45482. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45483. },
  45484. "port_directions": {
  45485. "I0": "input",
  45486. "I1": "input",
  45487. "I2": "input",
  45488. "I3": "input",
  45489. "O": "output"
  45490. },
  45491. "connections": {
  45492. "I0": [ "0" ],
  45493. "I1": [ 1920 ],
  45494. "I2": [ 1921 ],
  45495. "I3": [ 1375 ],
  45496. "O": [ 1848 ]
  45497. }
  45498. },
  45499. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  45500. "hide_name": 0,
  45501. "type": "SB_LUT4",
  45502. "parameters": {
  45503. "LUT_INIT": "1011100000000000"
  45504. },
  45505. "attributes": {
  45506. "module_not_derived": "00000000000000000000000000000001",
  45507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45508. },
  45509. "port_directions": {
  45510. "I0": "input",
  45511. "I1": "input",
  45512. "I2": "input",
  45513. "I3": "input",
  45514. "O": "output"
  45515. },
  45516. "connections": {
  45517. "I0": [ 1505 ],
  45518. "I1": [ 1378 ],
  45519. "I2": [ 1922 ],
  45520. "I3": [ 1380 ],
  45521. "O": [ 1847 ]
  45522. }
  45523. },
  45524. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  45525. "hide_name": 0,
  45526. "type": "SB_LUT4",
  45527. "parameters": {
  45528. "LUT_INIT": "0110100110010110"
  45529. },
  45530. "attributes": {
  45531. "module_not_derived": "00000000000000000000000000000001",
  45532. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45533. },
  45534. "port_directions": {
  45535. "I0": "input",
  45536. "I1": "input",
  45537. "I2": "input",
  45538. "I3": "input",
  45539. "O": "output"
  45540. },
  45541. "connections": {
  45542. "I0": [ "0" ],
  45543. "I1": [ "0" ],
  45544. "I2": [ 1504 ],
  45545. "I3": [ 1923 ],
  45546. "O": [ 1922 ]
  45547. }
  45548. },
  45549. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  45550. "hide_name": 0,
  45551. "type": "SB_CARRY",
  45552. "parameters": {
  45553. },
  45554. "attributes": {
  45555. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45556. },
  45557. "port_directions": {
  45558. "CI": "input",
  45559. "CO": "output",
  45560. "I0": "input",
  45561. "I1": "input"
  45562. },
  45563. "connections": {
  45564. "CI": [ 1924 ],
  45565. "CO": [ 1923 ],
  45566. "I0": [ "0" ],
  45567. "I1": [ 1508 ]
  45568. }
  45569. },
  45570. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  45571. "hide_name": 0,
  45572. "type": "SB_CARRY",
  45573. "parameters": {
  45574. },
  45575. "attributes": {
  45576. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45577. },
  45578. "port_directions": {
  45579. "CI": "input",
  45580. "CO": "output",
  45581. "I0": "input",
  45582. "I1": "input"
  45583. },
  45584. "connections": {
  45585. "CI": [ 1435 ],
  45586. "CO": [ 1924 ],
  45587. "I0": [ "0" ],
  45588. "I1": [ 1434 ]
  45589. }
  45590. },
  45591. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3": {
  45592. "hide_name": 0,
  45593. "type": "SB_LUT4",
  45594. "parameters": {
  45595. "LUT_INIT": "0110100110010110"
  45596. },
  45597. "attributes": {
  45598. "module_not_derived": "00000000000000000000000000000001",
  45599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45600. },
  45601. "port_directions": {
  45602. "I0": "input",
  45603. "I1": "input",
  45604. "I2": "input",
  45605. "I3": "input",
  45606. "O": "output"
  45607. },
  45608. "connections": {
  45609. "I0": [ "0" ],
  45610. "I1": [ "0" ],
  45611. "I2": [ 1508 ],
  45612. "I3": [ 1924 ],
  45613. "O": [ 1819 ]
  45614. }
  45615. },
  45616. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O": {
  45617. "hide_name": 0,
  45618. "type": "SB_LUT4",
  45619. "parameters": {
  45620. "LUT_INIT": "0000000000000011"
  45621. },
  45622. "attributes": {
  45623. "module_not_derived": "00000000000000000000000000000001",
  45624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45625. },
  45626. "port_directions": {
  45627. "I0": "input",
  45628. "I1": "input",
  45629. "I2": "input",
  45630. "I3": "input",
  45631. "O": "output"
  45632. },
  45633. "connections": {
  45634. "I0": [ "0" ],
  45635. "I1": [ 1391 ],
  45636. "I2": [ 1471 ],
  45637. "I3": [ 1023 ],
  45638. "O": [ 1380 ]
  45639. }
  45640. },
  45641. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  45642. "hide_name": 0,
  45643. "type": "SB_LUT4",
  45644. "parameters": {
  45645. "LUT_INIT": "0011111100110101"
  45646. },
  45647. "attributes": {
  45648. "module_not_derived": "00000000000000000000000000000001",
  45649. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45650. },
  45651. "port_directions": {
  45652. "I0": "input",
  45653. "I1": "input",
  45654. "I2": "input",
  45655. "I3": "input",
  45656. "O": "output"
  45657. },
  45658. "connections": {
  45659. "I0": [ 1205 ],
  45660. "I1": [ 1086 ],
  45661. "I2": [ 1050 ],
  45662. "I3": [ 1052 ],
  45663. "O": [ 1921 ]
  45664. }
  45665. },
  45666. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2": {
  45667. "hide_name": 0,
  45668. "type": "SB_LUT4",
  45669. "parameters": {
  45670. "LUT_INIT": "1111100011111111"
  45671. },
  45672. "attributes": {
  45673. "module_not_derived": "00000000000000000000000000000001",
  45674. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45675. },
  45676. "port_directions": {
  45677. "I0": "input",
  45678. "I1": "input",
  45679. "I2": "input",
  45680. "I3": "input",
  45681. "O": "output"
  45682. },
  45683. "connections": {
  45684. "I0": [ 1925 ],
  45685. "I1": [ 1367 ],
  45686. "I2": [ 1926 ],
  45687. "I3": [ 1927 ],
  45688. "O": [ 1834 ]
  45689. }
  45690. },
  45691. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20": {
  45692. "hide_name": 0,
  45693. "type": "SB_LUT4",
  45694. "parameters": {
  45695. "LUT_INIT": "1110111111001111"
  45696. },
  45697. "attributes": {
  45698. "module_not_derived": "00000000000000000000000000000001",
  45699. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45700. },
  45701. "port_directions": {
  45702. "I0": "input",
  45703. "I1": "input",
  45704. "I2": "input",
  45705. "I3": "input",
  45706. "O": "output"
  45707. },
  45708. "connections": {
  45709. "I0": [ 1367 ],
  45710. "I1": [ 1928 ],
  45711. "I2": [ 1929 ],
  45712. "I3": [ 1930 ],
  45713. "O": [ 1553 ]
  45714. }
  45715. },
  45716. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O": {
  45717. "hide_name": 0,
  45718. "type": "SB_LUT4",
  45719. "parameters": {
  45720. "LUT_INIT": "0011000011110000"
  45721. },
  45722. "attributes": {
  45723. "module_not_derived": "00000000000000000000000000000001",
  45724. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45725. },
  45726. "port_directions": {
  45727. "I0": "input",
  45728. "I1": "input",
  45729. "I2": "input",
  45730. "I3": "input",
  45731. "O": "output"
  45732. },
  45733. "connections": {
  45734. "I0": [ "0" ],
  45735. "I1": [ 1931 ],
  45736. "I2": [ 1932 ],
  45737. "I3": [ 1375 ],
  45738. "O": [ 1929 ]
  45739. }
  45740. },
  45741. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_1": {
  45742. "hide_name": 0,
  45743. "type": "SB_LUT4",
  45744. "parameters": {
  45745. "LUT_INIT": "1011000010000000"
  45746. },
  45747. "attributes": {
  45748. "module_not_derived": "00000000000000000000000000000001",
  45749. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45750. },
  45751. "port_directions": {
  45752. "I0": "input",
  45753. "I1": "input",
  45754. "I2": "input",
  45755. "I3": "input",
  45756. "O": "output"
  45757. },
  45758. "connections": {
  45759. "I0": [ 1483 ],
  45760. "I1": [ 1378 ],
  45761. "I2": [ 1380 ],
  45762. "I3": [ 1933 ],
  45763. "O": [ 1928 ]
  45764. }
  45765. },
  45766. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  45767. "hide_name": 0,
  45768. "type": "SB_LUT4",
  45769. "parameters": {
  45770. "LUT_INIT": "0110100110010110"
  45771. },
  45772. "attributes": {
  45773. "module_not_derived": "00000000000000000000000000000001",
  45774. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45775. },
  45776. "port_directions": {
  45777. "I0": "input",
  45778. "I1": "input",
  45779. "I2": "input",
  45780. "I3": "input",
  45781. "O": "output"
  45782. },
  45783. "connections": {
  45784. "I0": [ "0" ],
  45785. "I1": [ "0" ],
  45786. "I2": [ 1482 ],
  45787. "I3": [ 1934 ],
  45788. "O": [ 1933 ]
  45789. }
  45790. },
  45791. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  45792. "hide_name": 0,
  45793. "type": "SB_CARRY",
  45794. "parameters": {
  45795. },
  45796. "attributes": {
  45797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45798. },
  45799. "port_directions": {
  45800. "CI": "input",
  45801. "CO": "output",
  45802. "I0": "input",
  45803. "I1": "input"
  45804. },
  45805. "connections": {
  45806. "CI": [ 1919 ],
  45807. "CO": [ 1934 ],
  45808. "I0": [ "0" ],
  45809. "I1": [ 1484 ]
  45810. }
  45811. },
  45812. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  45813. "hide_name": 0,
  45814. "type": "SB_LUT4",
  45815. "parameters": {
  45816. "LUT_INIT": "0011111100110101"
  45817. },
  45818. "attributes": {
  45819. "module_not_derived": "00000000000000000000000000000001",
  45820. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45821. },
  45822. "port_directions": {
  45823. "I0": "input",
  45824. "I1": "input",
  45825. "I2": "input",
  45826. "I3": "input",
  45827. "O": "output"
  45828. },
  45829. "connections": {
  45830. "I0": [ 1184 ],
  45831. "I1": [ 1062 ],
  45832. "I2": [ 1050 ],
  45833. "I3": [ 1052 ],
  45834. "O": [ 1932 ]
  45835. }
  45836. },
  45837. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O": {
  45838. "hide_name": 0,
  45839. "type": "SB_LUT4",
  45840. "parameters": {
  45841. "LUT_INIT": "0011000011110000"
  45842. },
  45843. "attributes": {
  45844. "module_not_derived": "00000000000000000000000000000001",
  45845. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45846. },
  45847. "port_directions": {
  45848. "I0": "input",
  45849. "I1": "input",
  45850. "I2": "input",
  45851. "I3": "input",
  45852. "O": "output"
  45853. },
  45854. "connections": {
  45855. "I0": [ "0" ],
  45856. "I1": [ 1935 ],
  45857. "I2": [ 1936 ],
  45858. "I3": [ 1375 ],
  45859. "O": [ 1927 ]
  45860. }
  45861. },
  45862. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_1": {
  45863. "hide_name": 0,
  45864. "type": "SB_LUT4",
  45865. "parameters": {
  45866. "LUT_INIT": "1011100000000000"
  45867. },
  45868. "attributes": {
  45869. "module_not_derived": "00000000000000000000000000000001",
  45870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45871. },
  45872. "port_directions": {
  45873. "I0": "input",
  45874. "I1": "input",
  45875. "I2": "input",
  45876. "I3": "input",
  45877. "O": "output"
  45878. },
  45879. "connections": {
  45880. "I0": [ 1503 ],
  45881. "I1": [ 1378 ],
  45882. "I2": [ 1937 ],
  45883. "I3": [ 1380 ],
  45884. "O": [ 1926 ]
  45885. }
  45886. },
  45887. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  45888. "hide_name": 0,
  45889. "type": "SB_LUT4",
  45890. "parameters": {
  45891. "LUT_INIT": "0110100110010110"
  45892. },
  45893. "attributes": {
  45894. "module_not_derived": "00000000000000000000000000000001",
  45895. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45896. },
  45897. "port_directions": {
  45898. "I0": "input",
  45899. "I1": "input",
  45900. "I2": "input",
  45901. "I3": "input",
  45902. "O": "output"
  45903. },
  45904. "connections": {
  45905. "I0": [ "0" ],
  45906. "I1": [ "0" ],
  45907. "I2": [ 1502 ],
  45908. "I3": [ 1938 ],
  45909. "O": [ 1937 ]
  45910. }
  45911. },
  45912. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  45913. "hide_name": 0,
  45914. "type": "SB_CARRY",
  45915. "parameters": {
  45916. },
  45917. "attributes": {
  45918. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  45919. },
  45920. "port_directions": {
  45921. "CI": "input",
  45922. "CO": "output",
  45923. "I0": "input",
  45924. "I1": "input"
  45925. },
  45926. "connections": {
  45927. "CI": [ 1923 ],
  45928. "CO": [ 1938 ],
  45929. "I0": [ "0" ],
  45930. "I1": [ 1504 ]
  45931. }
  45932. },
  45933. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  45934. "hide_name": 0,
  45935. "type": "SB_LUT4",
  45936. "parameters": {
  45937. "LUT_INIT": "0011111100110101"
  45938. },
  45939. "attributes": {
  45940. "module_not_derived": "00000000000000000000000000000001",
  45941. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45942. },
  45943. "port_directions": {
  45944. "I0": "input",
  45945. "I1": "input",
  45946. "I2": "input",
  45947. "I3": "input",
  45948. "O": "output"
  45949. },
  45950. "connections": {
  45951. "I0": [ 1204 ],
  45952. "I1": [ 1084 ],
  45953. "I2": [ 1050 ],
  45954. "I3": [ 1052 ],
  45955. "O": [ 1936 ]
  45956. }
  45957. },
  45958. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3": {
  45959. "hide_name": 0,
  45960. "type": "SB_LUT4",
  45961. "parameters": {
  45962. "LUT_INIT": "1111100011111111"
  45963. },
  45964. "attributes": {
  45965. "module_not_derived": "00000000000000000000000000000001",
  45966. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  45967. },
  45968. "port_directions": {
  45969. "I0": "input",
  45970. "I1": "input",
  45971. "I2": "input",
  45972. "I3": "input",
  45973. "O": "output"
  45974. },
  45975. "connections": {
  45976. "I0": [ 1939 ],
  45977. "I1": [ 1367 ],
  45978. "I2": [ 1940 ],
  45979. "I3": [ 1941 ],
  45980. "O": [ 1833 ]
  45981. }
  45982. },
  45983. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O": {
  45984. "hide_name": 0,
  45985. "type": "SB_LUT4",
  45986. "parameters": {
  45987. "LUT_INIT": "0011000011110000"
  45988. },
  45989. "attributes": {
  45990. "module_not_derived": "00000000000000000000000000000001",
  45991. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  45992. },
  45993. "port_directions": {
  45994. "I0": "input",
  45995. "I1": "input",
  45996. "I2": "input",
  45997. "I3": "input",
  45998. "O": "output"
  45999. },
  46000. "connections": {
  46001. "I0": [ "0" ],
  46002. "I1": [ 1942 ],
  46003. "I2": [ 1943 ],
  46004. "I3": [ 1375 ],
  46005. "O": [ 1941 ]
  46006. }
  46007. },
  46008. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_1": {
  46009. "hide_name": 0,
  46010. "type": "SB_LUT4",
  46011. "parameters": {
  46012. "LUT_INIT": "1011100000000000"
  46013. },
  46014. "attributes": {
  46015. "module_not_derived": "00000000000000000000000000000001",
  46016. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46017. },
  46018. "port_directions": {
  46019. "I0": "input",
  46020. "I1": "input",
  46021. "I2": "input",
  46022. "I3": "input",
  46023. "O": "output"
  46024. },
  46025. "connections": {
  46026. "I0": [ 1501 ],
  46027. "I1": [ 1378 ],
  46028. "I2": [ 1944 ],
  46029. "I3": [ 1380 ],
  46030. "O": [ 1940 ]
  46031. }
  46032. },
  46033. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46034. "hide_name": 0,
  46035. "type": "SB_LUT4",
  46036. "parameters": {
  46037. "LUT_INIT": "0110100110010110"
  46038. },
  46039. "attributes": {
  46040. "module_not_derived": "00000000000000000000000000000001",
  46041. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46042. },
  46043. "port_directions": {
  46044. "I0": "input",
  46045. "I1": "input",
  46046. "I2": "input",
  46047. "I3": "input",
  46048. "O": "output"
  46049. },
  46050. "connections": {
  46051. "I0": [ "0" ],
  46052. "I1": [ "0" ],
  46053. "I2": [ 1500 ],
  46054. "I3": [ 1945 ],
  46055. "O": [ 1944 ]
  46056. }
  46057. },
  46058. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46059. "hide_name": 0,
  46060. "type": "SB_CARRY",
  46061. "parameters": {
  46062. },
  46063. "attributes": {
  46064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46065. },
  46066. "port_directions": {
  46067. "CI": "input",
  46068. "CO": "output",
  46069. "I0": "input",
  46070. "I1": "input"
  46071. },
  46072. "connections": {
  46073. "CI": [ 1938 ],
  46074. "CO": [ 1945 ],
  46075. "I0": [ "0" ],
  46076. "I1": [ 1502 ]
  46077. }
  46078. },
  46079. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46080. "hide_name": 0,
  46081. "type": "SB_LUT4",
  46082. "parameters": {
  46083. "LUT_INIT": "0011111100110101"
  46084. },
  46085. "attributes": {
  46086. "module_not_derived": "00000000000000000000000000000001",
  46087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46088. },
  46089. "port_directions": {
  46090. "I0": "input",
  46091. "I1": "input",
  46092. "I2": "input",
  46093. "I3": "input",
  46094. "O": "output"
  46095. },
  46096. "connections": {
  46097. "I0": [ 1202 ],
  46098. "I1": [ 1082 ],
  46099. "I2": [ 1050 ],
  46100. "I3": [ 1052 ],
  46101. "O": [ 1943 ]
  46102. }
  46103. },
  46104. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4": {
  46105. "hide_name": 0,
  46106. "type": "SB_LUT4",
  46107. "parameters": {
  46108. "LUT_INIT": "1111100011111111"
  46109. },
  46110. "attributes": {
  46111. "module_not_derived": "00000000000000000000000000000001",
  46112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46113. },
  46114. "port_directions": {
  46115. "I0": "input",
  46116. "I1": "input",
  46117. "I2": "input",
  46118. "I3": "input",
  46119. "O": "output"
  46120. },
  46121. "connections": {
  46122. "I0": [ 1946 ],
  46123. "I1": [ 1367 ],
  46124. "I2": [ 1947 ],
  46125. "I3": [ 1948 ],
  46126. "O": [ 1832 ]
  46127. }
  46128. },
  46129. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O": {
  46130. "hide_name": 0,
  46131. "type": "SB_LUT4",
  46132. "parameters": {
  46133. "LUT_INIT": "0011000011110000"
  46134. },
  46135. "attributes": {
  46136. "module_not_derived": "00000000000000000000000000000001",
  46137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  46138. },
  46139. "port_directions": {
  46140. "I0": "input",
  46141. "I1": "input",
  46142. "I2": "input",
  46143. "I3": "input",
  46144. "O": "output"
  46145. },
  46146. "connections": {
  46147. "I0": [ "0" ],
  46148. "I1": [ 1949 ],
  46149. "I2": [ 1950 ],
  46150. "I3": [ 1375 ],
  46151. "O": [ 1948 ]
  46152. }
  46153. },
  46154. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_1": {
  46155. "hide_name": 0,
  46156. "type": "SB_LUT4",
  46157. "parameters": {
  46158. "LUT_INIT": "1011100000000000"
  46159. },
  46160. "attributes": {
  46161. "module_not_derived": "00000000000000000000000000000001",
  46162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46163. },
  46164. "port_directions": {
  46165. "I0": "input",
  46166. "I1": "input",
  46167. "I2": "input",
  46168. "I3": "input",
  46169. "O": "output"
  46170. },
  46171. "connections": {
  46172. "I0": [ 1499 ],
  46173. "I1": [ 1378 ],
  46174. "I2": [ 1951 ],
  46175. "I3": [ 1380 ],
  46176. "O": [ 1947 ]
  46177. }
  46178. },
  46179. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46180. "hide_name": 0,
  46181. "type": "SB_LUT4",
  46182. "parameters": {
  46183. "LUT_INIT": "0110100110010110"
  46184. },
  46185. "attributes": {
  46186. "module_not_derived": "00000000000000000000000000000001",
  46187. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46188. },
  46189. "port_directions": {
  46190. "I0": "input",
  46191. "I1": "input",
  46192. "I2": "input",
  46193. "I3": "input",
  46194. "O": "output"
  46195. },
  46196. "connections": {
  46197. "I0": [ "0" ],
  46198. "I1": [ "0" ],
  46199. "I2": [ 1498 ],
  46200. "I3": [ 1952 ],
  46201. "O": [ 1951 ]
  46202. }
  46203. },
  46204. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46205. "hide_name": 0,
  46206. "type": "SB_CARRY",
  46207. "parameters": {
  46208. },
  46209. "attributes": {
  46210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46211. },
  46212. "port_directions": {
  46213. "CI": "input",
  46214. "CO": "output",
  46215. "I0": "input",
  46216. "I1": "input"
  46217. },
  46218. "connections": {
  46219. "CI": [ 1945 ],
  46220. "CO": [ 1952 ],
  46221. "I0": [ "0" ],
  46222. "I1": [ 1500 ]
  46223. }
  46224. },
  46225. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46226. "hide_name": 0,
  46227. "type": "SB_LUT4",
  46228. "parameters": {
  46229. "LUT_INIT": "0011111100110101"
  46230. },
  46231. "attributes": {
  46232. "module_not_derived": "00000000000000000000000000000001",
  46233. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46234. },
  46235. "port_directions": {
  46236. "I0": "input",
  46237. "I1": "input",
  46238. "I2": "input",
  46239. "I3": "input",
  46240. "O": "output"
  46241. },
  46242. "connections": {
  46243. "I0": [ 1200 ],
  46244. "I1": [ 1080 ],
  46245. "I2": [ 1050 ],
  46246. "I3": [ 1052 ],
  46247. "O": [ 1950 ]
  46248. }
  46249. },
  46250. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5": {
  46251. "hide_name": 0,
  46252. "type": "SB_LUT4",
  46253. "parameters": {
  46254. "LUT_INIT": "1111100011111111"
  46255. },
  46256. "attributes": {
  46257. "module_not_derived": "00000000000000000000000000000001",
  46258. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46259. },
  46260. "port_directions": {
  46261. "I0": "input",
  46262. "I1": "input",
  46263. "I2": "input",
  46264. "I3": "input",
  46265. "O": "output"
  46266. },
  46267. "connections": {
  46268. "I0": [ 1953 ],
  46269. "I1": [ 1367 ],
  46270. "I2": [ 1954 ],
  46271. "I3": [ 1955 ],
  46272. "O": [ 1831 ]
  46273. }
  46274. },
  46275. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O": {
  46276. "hide_name": 0,
  46277. "type": "SB_LUT4",
  46278. "parameters": {
  46279. "LUT_INIT": "0011000011110000"
  46280. },
  46281. "attributes": {
  46282. "module_not_derived": "00000000000000000000000000000001",
  46283. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  46284. },
  46285. "port_directions": {
  46286. "I0": "input",
  46287. "I1": "input",
  46288. "I2": "input",
  46289. "I3": "input",
  46290. "O": "output"
  46291. },
  46292. "connections": {
  46293. "I0": [ "0" ],
  46294. "I1": [ 1956 ],
  46295. "I2": [ 1957 ],
  46296. "I3": [ 1375 ],
  46297. "O": [ 1955 ]
  46298. }
  46299. },
  46300. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  46301. "hide_name": 0,
  46302. "type": "SB_LUT4",
  46303. "parameters": {
  46304. "LUT_INIT": "1011100000000000"
  46305. },
  46306. "attributes": {
  46307. "module_not_derived": "00000000000000000000000000000001",
  46308. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46309. },
  46310. "port_directions": {
  46311. "I0": "input",
  46312. "I1": "input",
  46313. "I2": "input",
  46314. "I3": "input",
  46315. "O": "output"
  46316. },
  46317. "connections": {
  46318. "I0": [ 1497 ],
  46319. "I1": [ 1378 ],
  46320. "I2": [ 1958 ],
  46321. "I3": [ 1380 ],
  46322. "O": [ 1954 ]
  46323. }
  46324. },
  46325. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46326. "hide_name": 0,
  46327. "type": "SB_LUT4",
  46328. "parameters": {
  46329. "LUT_INIT": "0110100110010110"
  46330. },
  46331. "attributes": {
  46332. "module_not_derived": "00000000000000000000000000000001",
  46333. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46334. },
  46335. "port_directions": {
  46336. "I0": "input",
  46337. "I1": "input",
  46338. "I2": "input",
  46339. "I3": "input",
  46340. "O": "output"
  46341. },
  46342. "connections": {
  46343. "I0": [ "0" ],
  46344. "I1": [ "0" ],
  46345. "I2": [ 1496 ],
  46346. "I3": [ 1959 ],
  46347. "O": [ 1958 ]
  46348. }
  46349. },
  46350. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46351. "hide_name": 0,
  46352. "type": "SB_CARRY",
  46353. "parameters": {
  46354. },
  46355. "attributes": {
  46356. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46357. },
  46358. "port_directions": {
  46359. "CI": "input",
  46360. "CO": "output",
  46361. "I0": "input",
  46362. "I1": "input"
  46363. },
  46364. "connections": {
  46365. "CI": [ 1952 ],
  46366. "CO": [ 1959 ],
  46367. "I0": [ "0" ],
  46368. "I1": [ 1498 ]
  46369. }
  46370. },
  46371. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46372. "hide_name": 0,
  46373. "type": "SB_LUT4",
  46374. "parameters": {
  46375. "LUT_INIT": "0011111100110101"
  46376. },
  46377. "attributes": {
  46378. "module_not_derived": "00000000000000000000000000000001",
  46379. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46380. },
  46381. "port_directions": {
  46382. "I0": "input",
  46383. "I1": "input",
  46384. "I2": "input",
  46385. "I3": "input",
  46386. "O": "output"
  46387. },
  46388. "connections": {
  46389. "I0": [ 1198 ],
  46390. "I1": [ 1078 ],
  46391. "I2": [ 1050 ],
  46392. "I3": [ 1052 ],
  46393. "O": [ 1957 ]
  46394. }
  46395. },
  46396. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6": {
  46397. "hide_name": 0,
  46398. "type": "SB_LUT4",
  46399. "parameters": {
  46400. "LUT_INIT": "1111100011111111"
  46401. },
  46402. "attributes": {
  46403. "module_not_derived": "00000000000000000000000000000001",
  46404. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46405. },
  46406. "port_directions": {
  46407. "I0": "input",
  46408. "I1": "input",
  46409. "I2": "input",
  46410. "I3": "input",
  46411. "O": "output"
  46412. },
  46413. "connections": {
  46414. "I0": [ 1960 ],
  46415. "I1": [ 1367 ],
  46416. "I2": [ 1961 ],
  46417. "I3": [ 1962 ],
  46418. "O": [ 1830 ]
  46419. }
  46420. },
  46421. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O": {
  46422. "hide_name": 0,
  46423. "type": "SB_LUT4",
  46424. "parameters": {
  46425. "LUT_INIT": "0011000011110000"
  46426. },
  46427. "attributes": {
  46428. "module_not_derived": "00000000000000000000000000000001",
  46429. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  46430. },
  46431. "port_directions": {
  46432. "I0": "input",
  46433. "I1": "input",
  46434. "I2": "input",
  46435. "I3": "input",
  46436. "O": "output"
  46437. },
  46438. "connections": {
  46439. "I0": [ "0" ],
  46440. "I1": [ 1963 ],
  46441. "I2": [ 1964 ],
  46442. "I3": [ 1375 ],
  46443. "O": [ 1962 ]
  46444. }
  46445. },
  46446. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_1": {
  46447. "hide_name": 0,
  46448. "type": "SB_LUT4",
  46449. "parameters": {
  46450. "LUT_INIT": "1011100000000000"
  46451. },
  46452. "attributes": {
  46453. "module_not_derived": "00000000000000000000000000000001",
  46454. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46455. },
  46456. "port_directions": {
  46457. "I0": "input",
  46458. "I1": "input",
  46459. "I2": "input",
  46460. "I3": "input",
  46461. "O": "output"
  46462. },
  46463. "connections": {
  46464. "I0": [ 1495 ],
  46465. "I1": [ 1378 ],
  46466. "I2": [ 1965 ],
  46467. "I3": [ 1380 ],
  46468. "O": [ 1961 ]
  46469. }
  46470. },
  46471. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46472. "hide_name": 0,
  46473. "type": "SB_LUT4",
  46474. "parameters": {
  46475. "LUT_INIT": "0110100110010110"
  46476. },
  46477. "attributes": {
  46478. "module_not_derived": "00000000000000000000000000000001",
  46479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46480. },
  46481. "port_directions": {
  46482. "I0": "input",
  46483. "I1": "input",
  46484. "I2": "input",
  46485. "I3": "input",
  46486. "O": "output"
  46487. },
  46488. "connections": {
  46489. "I0": [ "0" ],
  46490. "I1": [ "0" ],
  46491. "I2": [ 1494 ],
  46492. "I3": [ 1966 ],
  46493. "O": [ 1965 ]
  46494. }
  46495. },
  46496. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46497. "hide_name": 0,
  46498. "type": "SB_CARRY",
  46499. "parameters": {
  46500. },
  46501. "attributes": {
  46502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46503. },
  46504. "port_directions": {
  46505. "CI": "input",
  46506. "CO": "output",
  46507. "I0": "input",
  46508. "I1": "input"
  46509. },
  46510. "connections": {
  46511. "CI": [ 1959 ],
  46512. "CO": [ 1966 ],
  46513. "I0": [ "0" ],
  46514. "I1": [ 1496 ]
  46515. }
  46516. },
  46517. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46518. "hide_name": 0,
  46519. "type": "SB_LUT4",
  46520. "parameters": {
  46521. "LUT_INIT": "0011111100110101"
  46522. },
  46523. "attributes": {
  46524. "module_not_derived": "00000000000000000000000000000001",
  46525. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46526. },
  46527. "port_directions": {
  46528. "I0": "input",
  46529. "I1": "input",
  46530. "I2": "input",
  46531. "I3": "input",
  46532. "O": "output"
  46533. },
  46534. "connections": {
  46535. "I0": [ 1196 ],
  46536. "I1": [ 1076 ],
  46537. "I2": [ 1050 ],
  46538. "I3": [ 1052 ],
  46539. "O": [ 1964 ]
  46540. }
  46541. },
  46542. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7": {
  46543. "hide_name": 0,
  46544. "type": "SB_LUT4",
  46545. "parameters": {
  46546. "LUT_INIT": "1111100011111111"
  46547. },
  46548. "attributes": {
  46549. "module_not_derived": "00000000000000000000000000000001",
  46550. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46551. },
  46552. "port_directions": {
  46553. "I0": "input",
  46554. "I1": "input",
  46555. "I2": "input",
  46556. "I3": "input",
  46557. "O": "output"
  46558. },
  46559. "connections": {
  46560. "I0": [ 1967 ],
  46561. "I1": [ 1367 ],
  46562. "I2": [ 1968 ],
  46563. "I3": [ 1969 ],
  46564. "O": [ 1829 ]
  46565. }
  46566. },
  46567. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O": {
  46568. "hide_name": 0,
  46569. "type": "SB_LUT4",
  46570. "parameters": {
  46571. "LUT_INIT": "0011000011110000"
  46572. },
  46573. "attributes": {
  46574. "module_not_derived": "00000000000000000000000000000001",
  46575. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  46576. },
  46577. "port_directions": {
  46578. "I0": "input",
  46579. "I1": "input",
  46580. "I2": "input",
  46581. "I3": "input",
  46582. "O": "output"
  46583. },
  46584. "connections": {
  46585. "I0": [ "0" ],
  46586. "I1": [ 1970 ],
  46587. "I2": [ 1971 ],
  46588. "I3": [ 1375 ],
  46589. "O": [ 1969 ]
  46590. }
  46591. },
  46592. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_1": {
  46593. "hide_name": 0,
  46594. "type": "SB_LUT4",
  46595. "parameters": {
  46596. "LUT_INIT": "1011100000000000"
  46597. },
  46598. "attributes": {
  46599. "module_not_derived": "00000000000000000000000000000001",
  46600. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46601. },
  46602. "port_directions": {
  46603. "I0": "input",
  46604. "I1": "input",
  46605. "I2": "input",
  46606. "I3": "input",
  46607. "O": "output"
  46608. },
  46609. "connections": {
  46610. "I0": [ 1493 ],
  46611. "I1": [ 1378 ],
  46612. "I2": [ 1972 ],
  46613. "I3": [ 1380 ],
  46614. "O": [ 1968 ]
  46615. }
  46616. },
  46617. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46618. "hide_name": 0,
  46619. "type": "SB_LUT4",
  46620. "parameters": {
  46621. "LUT_INIT": "0110100110010110"
  46622. },
  46623. "attributes": {
  46624. "module_not_derived": "00000000000000000000000000000001",
  46625. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46626. },
  46627. "port_directions": {
  46628. "I0": "input",
  46629. "I1": "input",
  46630. "I2": "input",
  46631. "I3": "input",
  46632. "O": "output"
  46633. },
  46634. "connections": {
  46635. "I0": [ "0" ],
  46636. "I1": [ "0" ],
  46637. "I2": [ 1492 ],
  46638. "I3": [ 1973 ],
  46639. "O": [ 1972 ]
  46640. }
  46641. },
  46642. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46643. "hide_name": 0,
  46644. "type": "SB_CARRY",
  46645. "parameters": {
  46646. },
  46647. "attributes": {
  46648. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46649. },
  46650. "port_directions": {
  46651. "CI": "input",
  46652. "CO": "output",
  46653. "I0": "input",
  46654. "I1": "input"
  46655. },
  46656. "connections": {
  46657. "CI": [ 1966 ],
  46658. "CO": [ 1973 ],
  46659. "I0": [ "0" ],
  46660. "I1": [ 1494 ]
  46661. }
  46662. },
  46663. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46664. "hide_name": 0,
  46665. "type": "SB_LUT4",
  46666. "parameters": {
  46667. "LUT_INIT": "0011111100110101"
  46668. },
  46669. "attributes": {
  46670. "module_not_derived": "00000000000000000000000000000001",
  46671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46672. },
  46673. "port_directions": {
  46674. "I0": "input",
  46675. "I1": "input",
  46676. "I2": "input",
  46677. "I3": "input",
  46678. "O": "output"
  46679. },
  46680. "connections": {
  46681. "I0": [ 1194 ],
  46682. "I1": [ 1074 ],
  46683. "I2": [ 1050 ],
  46684. "I3": [ 1052 ],
  46685. "O": [ 1971 ]
  46686. }
  46687. },
  46688. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8": {
  46689. "hide_name": 0,
  46690. "type": "SB_LUT4",
  46691. "parameters": {
  46692. "LUT_INIT": "1111100011111111"
  46693. },
  46694. "attributes": {
  46695. "module_not_derived": "00000000000000000000000000000001",
  46696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46697. },
  46698. "port_directions": {
  46699. "I0": "input",
  46700. "I1": "input",
  46701. "I2": "input",
  46702. "I3": "input",
  46703. "O": "output"
  46704. },
  46705. "connections": {
  46706. "I0": [ 1974 ],
  46707. "I1": [ 1367 ],
  46708. "I2": [ 1975 ],
  46709. "I3": [ 1976 ],
  46710. "O": [ 1828 ]
  46711. }
  46712. },
  46713. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O": {
  46714. "hide_name": 0,
  46715. "type": "SB_LUT4",
  46716. "parameters": {
  46717. "LUT_INIT": "0011000011110000"
  46718. },
  46719. "attributes": {
  46720. "module_not_derived": "00000000000000000000000000000001",
  46721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  46722. },
  46723. "port_directions": {
  46724. "I0": "input",
  46725. "I1": "input",
  46726. "I2": "input",
  46727. "I3": "input",
  46728. "O": "output"
  46729. },
  46730. "connections": {
  46731. "I0": [ "0" ],
  46732. "I1": [ 1977 ],
  46733. "I2": [ 1978 ],
  46734. "I3": [ 1375 ],
  46735. "O": [ 1976 ]
  46736. }
  46737. },
  46738. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_1": {
  46739. "hide_name": 0,
  46740. "type": "SB_LUT4",
  46741. "parameters": {
  46742. "LUT_INIT": "1011100000000000"
  46743. },
  46744. "attributes": {
  46745. "module_not_derived": "00000000000000000000000000000001",
  46746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46747. },
  46748. "port_directions": {
  46749. "I0": "input",
  46750. "I1": "input",
  46751. "I2": "input",
  46752. "I3": "input",
  46753. "O": "output"
  46754. },
  46755. "connections": {
  46756. "I0": [ 1491 ],
  46757. "I1": [ 1378 ],
  46758. "I2": [ 1979 ],
  46759. "I3": [ 1380 ],
  46760. "O": [ 1975 ]
  46761. }
  46762. },
  46763. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46764. "hide_name": 0,
  46765. "type": "SB_LUT4",
  46766. "parameters": {
  46767. "LUT_INIT": "0110100110010110"
  46768. },
  46769. "attributes": {
  46770. "module_not_derived": "00000000000000000000000000000001",
  46771. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46772. },
  46773. "port_directions": {
  46774. "I0": "input",
  46775. "I1": "input",
  46776. "I2": "input",
  46777. "I3": "input",
  46778. "O": "output"
  46779. },
  46780. "connections": {
  46781. "I0": [ "0" ],
  46782. "I1": [ "0" ],
  46783. "I2": [ 1490 ],
  46784. "I3": [ 1980 ],
  46785. "O": [ 1979 ]
  46786. }
  46787. },
  46788. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46789. "hide_name": 0,
  46790. "type": "SB_CARRY",
  46791. "parameters": {
  46792. },
  46793. "attributes": {
  46794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46795. },
  46796. "port_directions": {
  46797. "CI": "input",
  46798. "CO": "output",
  46799. "I0": "input",
  46800. "I1": "input"
  46801. },
  46802. "connections": {
  46803. "CI": [ 1973 ],
  46804. "CO": [ 1980 ],
  46805. "I0": [ "0" ],
  46806. "I1": [ 1492 ]
  46807. }
  46808. },
  46809. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46810. "hide_name": 0,
  46811. "type": "SB_LUT4",
  46812. "parameters": {
  46813. "LUT_INIT": "0011111100110101"
  46814. },
  46815. "attributes": {
  46816. "module_not_derived": "00000000000000000000000000000001",
  46817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46818. },
  46819. "port_directions": {
  46820. "I0": "input",
  46821. "I1": "input",
  46822. "I2": "input",
  46823. "I3": "input",
  46824. "O": "output"
  46825. },
  46826. "connections": {
  46827. "I0": [ 1192 ],
  46828. "I1": [ 1072 ],
  46829. "I2": [ 1050 ],
  46830. "I3": [ 1052 ],
  46831. "O": [ 1978 ]
  46832. }
  46833. },
  46834. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9": {
  46835. "hide_name": 0,
  46836. "type": "SB_LUT4",
  46837. "parameters": {
  46838. "LUT_INIT": "1111100011111111"
  46839. },
  46840. "attributes": {
  46841. "module_not_derived": "00000000000000000000000000000001",
  46842. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46843. },
  46844. "port_directions": {
  46845. "I0": "input",
  46846. "I1": "input",
  46847. "I2": "input",
  46848. "I3": "input",
  46849. "O": "output"
  46850. },
  46851. "connections": {
  46852. "I0": [ 1981 ],
  46853. "I1": [ 1367 ],
  46854. "I2": [ 1982 ],
  46855. "I3": [ 1983 ],
  46856. "O": [ 1827 ]
  46857. }
  46858. },
  46859. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O": {
  46860. "hide_name": 0,
  46861. "type": "SB_LUT4",
  46862. "parameters": {
  46863. "LUT_INIT": "0011000011110000"
  46864. },
  46865. "attributes": {
  46866. "module_not_derived": "00000000000000000000000000000001",
  46867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  46868. },
  46869. "port_directions": {
  46870. "I0": "input",
  46871. "I1": "input",
  46872. "I2": "input",
  46873. "I3": "input",
  46874. "O": "output"
  46875. },
  46876. "connections": {
  46877. "I0": [ "0" ],
  46878. "I1": [ 1984 ],
  46879. "I2": [ 1985 ],
  46880. "I3": [ 1375 ],
  46881. "O": [ 1983 ]
  46882. }
  46883. },
  46884. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_1": {
  46885. "hide_name": 0,
  46886. "type": "SB_LUT4",
  46887. "parameters": {
  46888. "LUT_INIT": "1011100000000000"
  46889. },
  46890. "attributes": {
  46891. "module_not_derived": "00000000000000000000000000000001",
  46892. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46893. },
  46894. "port_directions": {
  46895. "I0": "input",
  46896. "I1": "input",
  46897. "I2": "input",
  46898. "I3": "input",
  46899. "O": "output"
  46900. },
  46901. "connections": {
  46902. "I0": [ 1489 ],
  46903. "I1": [ 1378 ],
  46904. "I2": [ 1986 ],
  46905. "I3": [ 1380 ],
  46906. "O": [ 1982 ]
  46907. }
  46908. },
  46909. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  46910. "hide_name": 0,
  46911. "type": "SB_LUT4",
  46912. "parameters": {
  46913. "LUT_INIT": "0110100110010110"
  46914. },
  46915. "attributes": {
  46916. "module_not_derived": "00000000000000000000000000000001",
  46917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46918. },
  46919. "port_directions": {
  46920. "I0": "input",
  46921. "I1": "input",
  46922. "I2": "input",
  46923. "I3": "input",
  46924. "O": "output"
  46925. },
  46926. "connections": {
  46927. "I0": [ "0" ],
  46928. "I1": [ "0" ],
  46929. "I2": [ 1488 ],
  46930. "I3": [ 1856 ],
  46931. "O": [ 1986 ]
  46932. }
  46933. },
  46934. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  46935. "hide_name": 0,
  46936. "type": "SB_CARRY",
  46937. "parameters": {
  46938. },
  46939. "attributes": {
  46940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  46941. },
  46942. "port_directions": {
  46943. "CI": "input",
  46944. "CO": "output",
  46945. "I0": "input",
  46946. "I1": "input"
  46947. },
  46948. "connections": {
  46949. "CI": [ 1980 ],
  46950. "CO": [ 1856 ],
  46951. "I0": [ "0" ],
  46952. "I1": [ 1490 ]
  46953. }
  46954. },
  46955. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  46956. "hide_name": 0,
  46957. "type": "SB_LUT4",
  46958. "parameters": {
  46959. "LUT_INIT": "0011111100110101"
  46960. },
  46961. "attributes": {
  46962. "module_not_derived": "00000000000000000000000000000001",
  46963. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46964. },
  46965. "port_directions": {
  46966. "I0": "input",
  46967. "I1": "input",
  46968. "I2": "input",
  46969. "I3": "input",
  46970. "O": "output"
  46971. },
  46972. "connections": {
  46973. "I0": [ 1190 ],
  46974. "I1": [ 1070 ],
  46975. "I2": [ 1050 ],
  46976. "I3": [ 1052 ],
  46977. "O": [ 1985 ]
  46978. }
  46979. },
  46980. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O": {
  46981. "hide_name": 0,
  46982. "type": "SB_LUT4",
  46983. "parameters": {
  46984. "LUT_INIT": "0110100110010110"
  46985. },
  46986. "attributes": {
  46987. "module_not_derived": "00000000000000000000000000000001",
  46988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  46989. },
  46990. "port_directions": {
  46991. "I0": "input",
  46992. "I1": "input",
  46993. "I2": "input",
  46994. "I3": "input",
  46995. "O": "output"
  46996. },
  46997. "connections": {
  46998. "I0": [ "0" ],
  46999. "I1": [ 1483 ],
  47000. "I2": [ 1821 ],
  47001. "I3": [ 1987 ],
  47002. "O": [ 1930 ]
  47003. }
  47004. },
  47005. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_1": {
  47006. "hide_name": 0,
  47007. "type": "SB_LUT4",
  47008. "parameters": {
  47009. "LUT_INIT": "0110100110010110"
  47010. },
  47011. "attributes": {
  47012. "module_not_derived": "00000000000000000000000000000001",
  47013. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47014. },
  47015. "port_directions": {
  47016. "I0": "input",
  47017. "I1": "input",
  47018. "I2": "input",
  47019. "I3": "input",
  47020. "O": "output"
  47021. },
  47022. "connections": {
  47023. "I0": [ "0" ],
  47024. "I1": [ 1509 ],
  47025. "I2": [ 1988 ],
  47026. "I3": [ 1989 ],
  47027. "O": [ 1845 ]
  47028. }
  47029. },
  47030. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_10": {
  47031. "hide_name": 0,
  47032. "type": "SB_LUT4",
  47033. "parameters": {
  47034. "LUT_INIT": "0110100110010110"
  47035. },
  47036. "attributes": {
  47037. "module_not_derived": "00000000000000000000000000000001",
  47038. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47039. },
  47040. "port_directions": {
  47041. "I0": "input",
  47042. "I1": "input",
  47043. "I2": "input",
  47044. "I3": "input",
  47045. "O": "output"
  47046. },
  47047. "connections": {
  47048. "I0": [ "0" ],
  47049. "I1": [ 1489 ],
  47050. "I2": [ 1821 ],
  47051. "I3": [ 1990 ],
  47052. "O": [ 1981 ]
  47053. }
  47054. },
  47055. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  47056. "hide_name": 0,
  47057. "type": "SB_CARRY",
  47058. "parameters": {
  47059. },
  47060. "attributes": {
  47061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47062. },
  47063. "port_directions": {
  47064. "CI": "input",
  47065. "CO": "output",
  47066. "I0": "input",
  47067. "I1": "input"
  47068. },
  47069. "connections": {
  47070. "CI": [ 1991 ],
  47071. "CO": [ 1990 ],
  47072. "I0": [ 1491 ],
  47073. "I1": [ 1992 ]
  47074. }
  47075. },
  47076. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_11": {
  47077. "hide_name": 0,
  47078. "type": "SB_LUT4",
  47079. "parameters": {
  47080. "LUT_INIT": "0110100110010110"
  47081. },
  47082. "attributes": {
  47083. "module_not_derived": "00000000000000000000000000000001",
  47084. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47085. },
  47086. "port_directions": {
  47087. "I0": "input",
  47088. "I1": "input",
  47089. "I2": "input",
  47090. "I3": "input",
  47091. "O": "output"
  47092. },
  47093. "connections": {
  47094. "I0": [ "0" ],
  47095. "I1": [ 1461 ],
  47096. "I2": [ 1993 ],
  47097. "I3": [ "0" ],
  47098. "O": [ 1436 ]
  47099. }
  47100. },
  47101. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_11_I2_SB_LUT4_O": {
  47102. "hide_name": 0,
  47103. "type": "SB_LUT4",
  47104. "parameters": {
  47105. "LUT_INIT": "1100110011110000"
  47106. },
  47107. "attributes": {
  47108. "module_not_derived": "00000000000000000000000000000001",
  47109. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  47110. },
  47111. "port_directions": {
  47112. "I0": "input",
  47113. "I1": "input",
  47114. "I2": "input",
  47115. "I3": "input",
  47116. "O": "output"
  47117. },
  47118. "connections": {
  47119. "I0": [ "0" ],
  47120. "I1": [ 1551 ],
  47121. "I2": [ 1541 ],
  47122. "I3": [ 1994 ],
  47123. "O": [ 1993 ]
  47124. }
  47125. },
  47126. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_12": {
  47127. "hide_name": 0,
  47128. "type": "SB_LUT4",
  47129. "parameters": {
  47130. "LUT_INIT": "0110100110010110"
  47131. },
  47132. "attributes": {
  47133. "module_not_derived": "00000000000000000000000000000001",
  47134. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47135. },
  47136. "port_directions": {
  47137. "I0": "input",
  47138. "I1": "input",
  47139. "I2": "input",
  47140. "I3": "input",
  47141. "O": "output"
  47142. },
  47143. "connections": {
  47144. "I0": [ "0" ],
  47145. "I1": [ 1487 ],
  47146. "I2": [ 1821 ],
  47147. "I3": [ 1995 ],
  47148. "O": [ 1849 ]
  47149. }
  47150. },
  47151. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  47152. "hide_name": 0,
  47153. "type": "SB_CARRY",
  47154. "parameters": {
  47155. },
  47156. "attributes": {
  47157. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47158. },
  47159. "port_directions": {
  47160. "CI": "input",
  47161. "CO": "output",
  47162. "I0": "input",
  47163. "I1": "input"
  47164. },
  47165. "connections": {
  47166. "CI": [ 1990 ],
  47167. "CO": [ 1995 ],
  47168. "I0": [ 1489 ],
  47169. "I1": [ 1821 ]
  47170. }
  47171. },
  47172. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_13": {
  47173. "hide_name": 0,
  47174. "type": "SB_LUT4",
  47175. "parameters": {
  47176. "LUT_INIT": "0110100110010110"
  47177. },
  47178. "attributes": {
  47179. "module_not_derived": "00000000000000000000000000000001",
  47180. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47181. },
  47182. "port_directions": {
  47183. "I0": "input",
  47184. "I1": "input",
  47185. "I2": "input",
  47186. "I3": "input",
  47187. "O": "output"
  47188. },
  47189. "connections": {
  47190. "I0": [ "0" ],
  47191. "I1": [ 1523 ],
  47192. "I2": [ 1821 ],
  47193. "I3": [ 1996 ],
  47194. "O": [ 1857 ]
  47195. }
  47196. },
  47197. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  47198. "hide_name": 0,
  47199. "type": "SB_CARRY",
  47200. "parameters": {
  47201. },
  47202. "attributes": {
  47203. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47204. },
  47205. "port_directions": {
  47206. "CI": "input",
  47207. "CO": "output",
  47208. "I0": "input",
  47209. "I1": "input"
  47210. },
  47211. "connections": {
  47212. "CI": [ 1995 ],
  47213. "CO": [ 1996 ],
  47214. "I0": [ 1487 ],
  47215. "I1": [ 1821 ]
  47216. }
  47217. },
  47218. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_14": {
  47219. "hide_name": 0,
  47220. "type": "SB_LUT4",
  47221. "parameters": {
  47222. "LUT_INIT": "0110100110010110"
  47223. },
  47224. "attributes": {
  47225. "module_not_derived": "00000000000000000000000000000001",
  47226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47227. },
  47228. "port_directions": {
  47229. "I0": "input",
  47230. "I1": "input",
  47231. "I2": "input",
  47232. "I3": "input",
  47233. "O": "output"
  47234. },
  47235. "connections": {
  47236. "I0": [ "0" ],
  47237. "I1": [ 1521 ],
  47238. "I2": [ 1821 ],
  47239. "I3": [ 1997 ],
  47240. "O": [ 1864 ]
  47241. }
  47242. },
  47243. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  47244. "hide_name": 0,
  47245. "type": "SB_CARRY",
  47246. "parameters": {
  47247. },
  47248. "attributes": {
  47249. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47250. },
  47251. "port_directions": {
  47252. "CI": "input",
  47253. "CO": "output",
  47254. "I0": "input",
  47255. "I1": "input"
  47256. },
  47257. "connections": {
  47258. "CI": [ 1996 ],
  47259. "CO": [ 1997 ],
  47260. "I0": [ 1523 ],
  47261. "I1": [ 1821 ]
  47262. }
  47263. },
  47264. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_15": {
  47265. "hide_name": 0,
  47266. "type": "SB_LUT4",
  47267. "parameters": {
  47268. "LUT_INIT": "0110100110010110"
  47269. },
  47270. "attributes": {
  47271. "module_not_derived": "00000000000000000000000000000001",
  47272. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47273. },
  47274. "port_directions": {
  47275. "I0": "input",
  47276. "I1": "input",
  47277. "I2": "input",
  47278. "I3": "input",
  47279. "O": "output"
  47280. },
  47281. "connections": {
  47282. "I0": [ "0" ],
  47283. "I1": [ 1519 ],
  47284. "I2": [ 1821 ],
  47285. "I3": [ 1998 ],
  47286. "O": [ 1871 ]
  47287. }
  47288. },
  47289. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  47290. "hide_name": 0,
  47291. "type": "SB_CARRY",
  47292. "parameters": {
  47293. },
  47294. "attributes": {
  47295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47296. },
  47297. "port_directions": {
  47298. "CI": "input",
  47299. "CO": "output",
  47300. "I0": "input",
  47301. "I1": "input"
  47302. },
  47303. "connections": {
  47304. "CI": [ 1997 ],
  47305. "CO": [ 1998 ],
  47306. "I0": [ 1521 ],
  47307. "I1": [ 1821 ]
  47308. }
  47309. },
  47310. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_16": {
  47311. "hide_name": 0,
  47312. "type": "SB_LUT4",
  47313. "parameters": {
  47314. "LUT_INIT": "0110100110010110"
  47315. },
  47316. "attributes": {
  47317. "module_not_derived": "00000000000000000000000000000001",
  47318. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47319. },
  47320. "port_directions": {
  47321. "I0": "input",
  47322. "I1": "input",
  47323. "I2": "input",
  47324. "I3": "input",
  47325. "O": "output"
  47326. },
  47327. "connections": {
  47328. "I0": [ "0" ],
  47329. "I1": [ 1517 ],
  47330. "I2": [ 1821 ],
  47331. "I3": [ 1999 ],
  47332. "O": [ 1878 ]
  47333. }
  47334. },
  47335. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  47336. "hide_name": 0,
  47337. "type": "SB_CARRY",
  47338. "parameters": {
  47339. },
  47340. "attributes": {
  47341. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47342. },
  47343. "port_directions": {
  47344. "CI": "input",
  47345. "CO": "output",
  47346. "I0": "input",
  47347. "I1": "input"
  47348. },
  47349. "connections": {
  47350. "CI": [ 1998 ],
  47351. "CO": [ 1999 ],
  47352. "I0": [ 1519 ],
  47353. "I1": [ 1821 ]
  47354. }
  47355. },
  47356. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_17": {
  47357. "hide_name": 0,
  47358. "type": "SB_LUT4",
  47359. "parameters": {
  47360. "LUT_INIT": "0110100110010110"
  47361. },
  47362. "attributes": {
  47363. "module_not_derived": "00000000000000000000000000000001",
  47364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47365. },
  47366. "port_directions": {
  47367. "I0": "input",
  47368. "I1": "input",
  47369. "I2": "input",
  47370. "I3": "input",
  47371. "O": "output"
  47372. },
  47373. "connections": {
  47374. "I0": [ "0" ],
  47375. "I1": [ 1515 ],
  47376. "I2": [ 1821 ],
  47377. "I3": [ 2000 ],
  47378. "O": [ 1885 ]
  47379. }
  47380. },
  47381. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_17_I3_SB_CARRY_CO": {
  47382. "hide_name": 0,
  47383. "type": "SB_CARRY",
  47384. "parameters": {
  47385. },
  47386. "attributes": {
  47387. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47388. },
  47389. "port_directions": {
  47390. "CI": "input",
  47391. "CO": "output",
  47392. "I0": "input",
  47393. "I1": "input"
  47394. },
  47395. "connections": {
  47396. "CI": [ 1999 ],
  47397. "CO": [ 2000 ],
  47398. "I0": [ 1517 ],
  47399. "I1": [ 1821 ]
  47400. }
  47401. },
  47402. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_18": {
  47403. "hide_name": 0,
  47404. "type": "SB_LUT4",
  47405. "parameters": {
  47406. "LUT_INIT": "0110100110010110"
  47407. },
  47408. "attributes": {
  47409. "module_not_derived": "00000000000000000000000000000001",
  47410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47411. },
  47412. "port_directions": {
  47413. "I0": "input",
  47414. "I1": "input",
  47415. "I2": "input",
  47416. "I3": "input",
  47417. "O": "output"
  47418. },
  47419. "connections": {
  47420. "I0": [ "0" ],
  47421. "I1": [ 1513 ],
  47422. "I2": [ 1821 ],
  47423. "I3": [ 2001 ],
  47424. "O": [ 1893 ]
  47425. }
  47426. },
  47427. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_18_I3_SB_CARRY_CO": {
  47428. "hide_name": 0,
  47429. "type": "SB_CARRY",
  47430. "parameters": {
  47431. },
  47432. "attributes": {
  47433. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47434. },
  47435. "port_directions": {
  47436. "CI": "input",
  47437. "CO": "output",
  47438. "I0": "input",
  47439. "I1": "input"
  47440. },
  47441. "connections": {
  47442. "CI": [ 2000 ],
  47443. "CO": [ 2001 ],
  47444. "I0": [ 1515 ],
  47445. "I1": [ 1821 ]
  47446. }
  47447. },
  47448. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_19": {
  47449. "hide_name": 0,
  47450. "type": "SB_LUT4",
  47451. "parameters": {
  47452. "LUT_INIT": "0110100110010110"
  47453. },
  47454. "attributes": {
  47455. "module_not_derived": "00000000000000000000000000000001",
  47456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47457. },
  47458. "port_directions": {
  47459. "I0": "input",
  47460. "I1": "input",
  47461. "I2": "input",
  47462. "I3": "input",
  47463. "O": "output"
  47464. },
  47465. "connections": {
  47466. "I0": [ "0" ],
  47467. "I1": [ 1511 ],
  47468. "I2": [ 1821 ],
  47469. "I3": [ 2002 ],
  47470. "O": [ 1900 ]
  47471. }
  47472. },
  47473. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_19_I3_SB_CARRY_CO": {
  47474. "hide_name": 0,
  47475. "type": "SB_CARRY",
  47476. "parameters": {
  47477. },
  47478. "attributes": {
  47479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47480. },
  47481. "port_directions": {
  47482. "CI": "input",
  47483. "CO": "output",
  47484. "I0": "input",
  47485. "I1": "input"
  47486. },
  47487. "connections": {
  47488. "CI": [ 2001 ],
  47489. "CO": [ 2002 ],
  47490. "I0": [ 1513 ],
  47491. "I1": [ 1821 ]
  47492. }
  47493. },
  47494. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  47495. "hide_name": 0,
  47496. "type": "SB_CARRY",
  47497. "parameters": {
  47498. },
  47499. "attributes": {
  47500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47501. },
  47502. "port_directions": {
  47503. "CI": "input",
  47504. "CO": "output",
  47505. "I0": "input",
  47506. "I1": "input"
  47507. },
  47508. "connections": {
  47509. "CI": [ 2003 ],
  47510. "CO": [ 1989 ],
  47511. "I0": [ 1432 ],
  47512. "I1": [ 1528 ]
  47513. }
  47514. },
  47515. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_2": {
  47516. "hide_name": 0,
  47517. "type": "SB_LUT4",
  47518. "parameters": {
  47519. "LUT_INIT": "0110100110010110"
  47520. },
  47521. "attributes": {
  47522. "module_not_derived": "00000000000000000000000000000001",
  47523. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47524. },
  47525. "port_directions": {
  47526. "I0": "input",
  47527. "I1": "input",
  47528. "I2": "input",
  47529. "I3": "input",
  47530. "O": "output"
  47531. },
  47532. "connections": {
  47533. "I0": [ "0" ],
  47534. "I1": [ 1505 ],
  47535. "I2": [ 2004 ],
  47536. "I3": [ 2005 ],
  47537. "O": [ 1846 ]
  47538. }
  47539. },
  47540. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_20": {
  47541. "hide_name": 0,
  47542. "type": "SB_LUT4",
  47543. "parameters": {
  47544. "LUT_INIT": "0110100110010110"
  47545. },
  47546. "attributes": {
  47547. "module_not_derived": "00000000000000000000000000000001",
  47548. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47549. },
  47550. "port_directions": {
  47551. "I0": "input",
  47552. "I1": "input",
  47553. "I2": "input",
  47554. "I3": "input",
  47555. "O": "output"
  47556. },
  47557. "connections": {
  47558. "I0": [ "0" ],
  47559. "I1": [ 1507 ],
  47560. "I2": [ 1821 ],
  47561. "I3": [ 2006 ],
  47562. "O": [ 1907 ]
  47563. }
  47564. },
  47565. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_20_I3_SB_CARRY_CO": {
  47566. "hide_name": 0,
  47567. "type": "SB_CARRY",
  47568. "parameters": {
  47569. },
  47570. "attributes": {
  47571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47572. },
  47573. "port_directions": {
  47574. "CI": "input",
  47575. "CO": "output",
  47576. "I0": "input",
  47577. "I1": "input"
  47578. },
  47579. "connections": {
  47580. "CI": [ 2002 ],
  47581. "CO": [ 2006 ],
  47582. "I0": [ 1511 ],
  47583. "I1": [ 1821 ]
  47584. }
  47585. },
  47586. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_21": {
  47587. "hide_name": 0,
  47588. "type": "SB_LUT4",
  47589. "parameters": {
  47590. "LUT_INIT": "0110100110010110"
  47591. },
  47592. "attributes": {
  47593. "module_not_derived": "00000000000000000000000000000001",
  47594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47595. },
  47596. "port_directions": {
  47597. "I0": "input",
  47598. "I1": "input",
  47599. "I2": "input",
  47600. "I3": "input",
  47601. "O": "output"
  47602. },
  47603. "connections": {
  47604. "I0": [ "0" ],
  47605. "I1": [ 1485 ],
  47606. "I2": [ 1821 ],
  47607. "I3": [ 2007 ],
  47608. "O": [ 1915 ]
  47609. }
  47610. },
  47611. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_21_I3_SB_CARRY_CO": {
  47612. "hide_name": 0,
  47613. "type": "SB_CARRY",
  47614. "parameters": {
  47615. },
  47616. "attributes": {
  47617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47618. },
  47619. "port_directions": {
  47620. "CI": "input",
  47621. "CO": "output",
  47622. "I0": "input",
  47623. "I1": "input"
  47624. },
  47625. "connections": {
  47626. "CI": [ 2006 ],
  47627. "CO": [ 2007 ],
  47628. "I0": [ 1507 ],
  47629. "I1": [ 1821 ]
  47630. }
  47631. },
  47632. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_22": {
  47633. "hide_name": 0,
  47634. "type": "SB_LUT4",
  47635. "parameters": {
  47636. "LUT_INIT": "0110100110010110"
  47637. },
  47638. "attributes": {
  47639. "module_not_derived": "00000000000000000000000000000001",
  47640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47641. },
  47642. "port_directions": {
  47643. "I0": "input",
  47644. "I1": "input",
  47645. "I2": "input",
  47646. "I3": "input",
  47647. "O": "output"
  47648. },
  47649. "connections": {
  47650. "I0": [ "0" ],
  47651. "I1": [ 1457 ],
  47652. "I2": [ 2008 ],
  47653. "I3": [ 2009 ],
  47654. "O": [ 1451 ]
  47655. }
  47656. },
  47657. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_22_I2_SB_LUT4_O": {
  47658. "hide_name": 0,
  47659. "type": "SB_LUT4",
  47660. "parameters": {
  47661. "LUT_INIT": "1100110011110000"
  47662. },
  47663. "attributes": {
  47664. "module_not_derived": "00000000000000000000000000000001",
  47665. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  47666. },
  47667. "port_directions": {
  47668. "I0": "input",
  47669. "I1": "input",
  47670. "I2": "input",
  47671. "I3": "input",
  47672. "O": "output"
  47673. },
  47674. "connections": {
  47675. "I0": [ "0" ],
  47676. "I1": [ 1550 ],
  47677. "I2": [ 1539 ],
  47678. "I3": [ 1994 ],
  47679. "O": [ 2008 ]
  47680. }
  47681. },
  47682. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_22_I3_SB_CARRY_CO": {
  47683. "hide_name": 0,
  47684. "type": "SB_CARRY",
  47685. "parameters": {
  47686. },
  47687. "attributes": {
  47688. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47689. },
  47690. "port_directions": {
  47691. "CI": "input",
  47692. "CO": "output",
  47693. "I0": "input",
  47694. "I1": "input"
  47695. },
  47696. "connections": {
  47697. "CI": [ "0" ],
  47698. "CO": [ 2009 ],
  47699. "I0": [ 1461 ],
  47700. "I1": [ 1993 ]
  47701. }
  47702. },
  47703. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_23": {
  47704. "hide_name": 0,
  47705. "type": "SB_LUT4",
  47706. "parameters": {
  47707. "LUT_INIT": "0110100110010110"
  47708. },
  47709. "attributes": {
  47710. "module_not_derived": "00000000000000000000000000000001",
  47711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47712. },
  47713. "port_directions": {
  47714. "I0": "input",
  47715. "I1": "input",
  47716. "I2": "input",
  47717. "I3": "input",
  47718. "O": "output"
  47719. },
  47720. "connections": {
  47721. "I0": [ "0" ],
  47722. "I1": [ 1446 ],
  47723. "I2": [ 2010 ],
  47724. "I3": [ 2011 ],
  47725. "O": [ 1440 ]
  47726. }
  47727. },
  47728. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_23_I2_SB_LUT4_O": {
  47729. "hide_name": 0,
  47730. "type": "SB_LUT4",
  47731. "parameters": {
  47732. "LUT_INIT": "1100110011110000"
  47733. },
  47734. "attributes": {
  47735. "module_not_derived": "00000000000000000000000000000001",
  47736. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  47737. },
  47738. "port_directions": {
  47739. "I0": "input",
  47740. "I1": "input",
  47741. "I2": "input",
  47742. "I3": "input",
  47743. "O": "output"
  47744. },
  47745. "connections": {
  47746. "I0": [ "0" ],
  47747. "I1": [ 1549 ],
  47748. "I2": [ 1538 ],
  47749. "I3": [ 1994 ],
  47750. "O": [ 2010 ]
  47751. }
  47752. },
  47753. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_23_I3_SB_CARRY_CO": {
  47754. "hide_name": 0,
  47755. "type": "SB_CARRY",
  47756. "parameters": {
  47757. },
  47758. "attributes": {
  47759. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47760. },
  47761. "port_directions": {
  47762. "CI": "input",
  47763. "CO": "output",
  47764. "I0": "input",
  47765. "I1": "input"
  47766. },
  47767. "connections": {
  47768. "CI": [ 2009 ],
  47769. "CO": [ 2011 ],
  47770. "I0": [ 1457 ],
  47771. "I1": [ 2008 ]
  47772. }
  47773. },
  47774. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_24": {
  47775. "hide_name": 0,
  47776. "type": "SB_LUT4",
  47777. "parameters": {
  47778. "LUT_INIT": "0110100110010110"
  47779. },
  47780. "attributes": {
  47781. "module_not_derived": "00000000000000000000000000000001",
  47782. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47783. },
  47784. "port_directions": {
  47785. "I0": "input",
  47786. "I1": "input",
  47787. "I2": "input",
  47788. "I3": "input",
  47789. "O": "output"
  47790. },
  47791. "connections": {
  47792. "I0": [ "0" ],
  47793. "I1": [ 1422 ],
  47794. "I2": [ 1548 ],
  47795. "I3": [ 2012 ],
  47796. "O": [ 1416 ]
  47797. }
  47798. },
  47799. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_24_I3_SB_CARRY_CO": {
  47800. "hide_name": 0,
  47801. "type": "SB_CARRY",
  47802. "parameters": {
  47803. },
  47804. "attributes": {
  47805. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47806. },
  47807. "port_directions": {
  47808. "CI": "input",
  47809. "CO": "output",
  47810. "I0": "input",
  47811. "I1": "input"
  47812. },
  47813. "connections": {
  47814. "CI": [ 2011 ],
  47815. "CO": [ 2012 ],
  47816. "I0": [ 1446 ],
  47817. "I1": [ 2010 ]
  47818. }
  47819. },
  47820. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_25": {
  47821. "hide_name": 0,
  47822. "type": "SB_LUT4",
  47823. "parameters": {
  47824. "LUT_INIT": "0110100110010110"
  47825. },
  47826. "attributes": {
  47827. "module_not_derived": "00000000000000000000000000000001",
  47828. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47829. },
  47830. "port_directions": {
  47831. "I0": "input",
  47832. "I1": "input",
  47833. "I2": "input",
  47834. "I3": "input",
  47835. "O": "output"
  47836. },
  47837. "connections": {
  47838. "I0": [ "0" ],
  47839. "I1": [ 1414 ],
  47840. "I2": [ 1547 ],
  47841. "I3": [ 2013 ],
  47842. "O": [ 1408 ]
  47843. }
  47844. },
  47845. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_25_I3_SB_CARRY_CO": {
  47846. "hide_name": 0,
  47847. "type": "SB_CARRY",
  47848. "parameters": {
  47849. },
  47850. "attributes": {
  47851. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47852. },
  47853. "port_directions": {
  47854. "CI": "input",
  47855. "CO": "output",
  47856. "I0": "input",
  47857. "I1": "input"
  47858. },
  47859. "connections": {
  47860. "CI": [ 2012 ],
  47861. "CO": [ 2013 ],
  47862. "I0": [ 1422 ],
  47863. "I1": [ 1548 ]
  47864. }
  47865. },
  47866. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_26": {
  47867. "hide_name": 0,
  47868. "type": "SB_LUT4",
  47869. "parameters": {
  47870. "LUT_INIT": "0110100110010110"
  47871. },
  47872. "attributes": {
  47873. "module_not_derived": "00000000000000000000000000000001",
  47874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47875. },
  47876. "port_directions": {
  47877. "I0": "input",
  47878. "I1": "input",
  47879. "I2": "input",
  47880. "I3": "input",
  47881. "O": "output"
  47882. },
  47883. "connections": {
  47884. "I0": [ "0" ],
  47885. "I1": [ 1404 ],
  47886. "I2": [ 1546 ],
  47887. "I3": [ 2014 ],
  47888. "O": [ 1398 ]
  47889. }
  47890. },
  47891. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_26_I3_SB_CARRY_CO": {
  47892. "hide_name": 0,
  47893. "type": "SB_CARRY",
  47894. "parameters": {
  47895. },
  47896. "attributes": {
  47897. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47898. },
  47899. "port_directions": {
  47900. "CI": "input",
  47901. "CO": "output",
  47902. "I0": "input",
  47903. "I1": "input"
  47904. },
  47905. "connections": {
  47906. "CI": [ 2013 ],
  47907. "CO": [ 2014 ],
  47908. "I0": [ 1414 ],
  47909. "I1": [ 1547 ]
  47910. }
  47911. },
  47912. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_27": {
  47913. "hide_name": 0,
  47914. "type": "SB_LUT4",
  47915. "parameters": {
  47916. "LUT_INIT": "0110100110010110"
  47917. },
  47918. "attributes": {
  47919. "module_not_derived": "00000000000000000000000000000001",
  47920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47921. },
  47922. "port_directions": {
  47923. "I0": "input",
  47924. "I1": "input",
  47925. "I2": "input",
  47926. "I3": "input",
  47927. "O": "output"
  47928. },
  47929. "connections": {
  47930. "I0": [ "0" ],
  47931. "I1": [ 1394 ],
  47932. "I2": [ 1540 ],
  47933. "I3": [ 2015 ],
  47934. "O": [ 1385 ]
  47935. }
  47936. },
  47937. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_27_I3_SB_CARRY_CO": {
  47938. "hide_name": 0,
  47939. "type": "SB_CARRY",
  47940. "parameters": {
  47941. },
  47942. "attributes": {
  47943. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47944. },
  47945. "port_directions": {
  47946. "CI": "input",
  47947. "CO": "output",
  47948. "I0": "input",
  47949. "I1": "input"
  47950. },
  47951. "connections": {
  47952. "CI": [ 2014 ],
  47953. "CO": [ 2015 ],
  47954. "I0": [ 1404 ],
  47955. "I1": [ 1546 ]
  47956. }
  47957. },
  47958. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_28": {
  47959. "hide_name": 0,
  47960. "type": "SB_LUT4",
  47961. "parameters": {
  47962. "LUT_INIT": "0110100110010110"
  47963. },
  47964. "attributes": {
  47965. "module_not_derived": "00000000000000000000000000000001",
  47966. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  47967. },
  47968. "port_directions": {
  47969. "I0": "input",
  47970. "I1": "input",
  47971. "I2": "input",
  47972. "I3": "input",
  47973. "O": "output"
  47974. },
  47975. "connections": {
  47976. "I0": [ "0" ],
  47977. "I1": [ 1377 ],
  47978. "I2": [ 1529 ],
  47979. "I3": [ 2016 ],
  47980. "O": [ 1370 ]
  47981. }
  47982. },
  47983. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_28_I3_SB_CARRY_CO": {
  47984. "hide_name": 0,
  47985. "type": "SB_CARRY",
  47986. "parameters": {
  47987. },
  47988. "attributes": {
  47989. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  47990. },
  47991. "port_directions": {
  47992. "CI": "input",
  47993. "CO": "output",
  47994. "I0": "input",
  47995. "I1": "input"
  47996. },
  47997. "connections": {
  47998. "CI": [ 2015 ],
  47999. "CO": [ 2016 ],
  48000. "I0": [ 1394 ],
  48001. "I1": [ 1540 ]
  48002. }
  48003. },
  48004. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_29": {
  48005. "hide_name": 0,
  48006. "type": "SB_LUT4",
  48007. "parameters": {
  48008. "LUT_INIT": "0110100110010110"
  48009. },
  48010. "attributes": {
  48011. "module_not_derived": "00000000000000000000000000000001",
  48012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48013. },
  48014. "port_directions": {
  48015. "I0": "input",
  48016. "I1": "input",
  48017. "I2": "input",
  48018. "I3": "input",
  48019. "O": "output"
  48020. },
  48021. "connections": {
  48022. "I0": [ "0" ],
  48023. "I1": [ 1432 ],
  48024. "I2": [ 1528 ],
  48025. "I3": [ 2003 ],
  48026. "O": [ 1366 ]
  48027. }
  48028. },
  48029. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_29_I3_SB_CARRY_CO": {
  48030. "hide_name": 0,
  48031. "type": "SB_CARRY",
  48032. "parameters": {
  48033. },
  48034. "attributes": {
  48035. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48036. },
  48037. "port_directions": {
  48038. "CI": "input",
  48039. "CO": "output",
  48040. "I0": "input",
  48041. "I1": "input"
  48042. },
  48043. "connections": {
  48044. "CI": [ 2016 ],
  48045. "CO": [ 2003 ],
  48046. "I0": [ 1377 ],
  48047. "I1": [ 1529 ]
  48048. }
  48049. },
  48050. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_2_I2_SB_LUT4_O": {
  48051. "hide_name": 0,
  48052. "type": "SB_LUT4",
  48053. "parameters": {
  48054. "LUT_INIT": "1111000011001100"
  48055. },
  48056. "attributes": {
  48057. "module_not_derived": "00000000000000000000000000000001",
  48058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48059. },
  48060. "port_directions": {
  48061. "I0": "input",
  48062. "I1": "input",
  48063. "I2": "input",
  48064. "I3": "input",
  48065. "O": "output"
  48066. },
  48067. "connections": {
  48068. "I0": [ "0" ],
  48069. "I1": [ 1821 ],
  48070. "I2": [ 1362 ],
  48071. "I3": [ 1994 ],
  48072. "O": [ 2004 ]
  48073. }
  48074. },
  48075. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  48076. "hide_name": 0,
  48077. "type": "SB_CARRY",
  48078. "parameters": {
  48079. },
  48080. "attributes": {
  48081. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48082. },
  48083. "port_directions": {
  48084. "CI": "input",
  48085. "CO": "output",
  48086. "I0": "input",
  48087. "I1": "input"
  48088. },
  48089. "connections": {
  48090. "CI": [ 1989 ],
  48091. "CO": [ 2005 ],
  48092. "I0": [ 1509 ],
  48093. "I1": [ 1988 ]
  48094. }
  48095. },
  48096. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_3": {
  48097. "hide_name": 0,
  48098. "type": "SB_LUT4",
  48099. "parameters": {
  48100. "LUT_INIT": "0110100110010110"
  48101. },
  48102. "attributes": {
  48103. "module_not_derived": "00000000000000000000000000000001",
  48104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48105. },
  48106. "port_directions": {
  48107. "I0": "input",
  48108. "I1": "input",
  48109. "I2": "input",
  48110. "I3": "input",
  48111. "O": "output"
  48112. },
  48113. "connections": {
  48114. "I0": [ "0" ],
  48115. "I1": [ 1503 ],
  48116. "I2": [ 2017 ],
  48117. "I3": [ 2018 ],
  48118. "O": [ 1925 ]
  48119. }
  48120. },
  48121. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_3_I2_SB_LUT4_O": {
  48122. "hide_name": 0,
  48123. "type": "SB_LUT4",
  48124. "parameters": {
  48125. "LUT_INIT": "1111000011001100"
  48126. },
  48127. "attributes": {
  48128. "module_not_derived": "00000000000000000000000000000001",
  48129. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48130. },
  48131. "port_directions": {
  48132. "I0": "input",
  48133. "I1": "input",
  48134. "I2": "input",
  48135. "I3": "input",
  48136. "O": "output"
  48137. },
  48138. "connections": {
  48139. "I0": [ "0" ],
  48140. "I1": [ 1821 ],
  48141. "I2": [ 1537 ],
  48142. "I3": [ 1994 ],
  48143. "O": [ 2017 ]
  48144. }
  48145. },
  48146. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  48147. "hide_name": 0,
  48148. "type": "SB_CARRY",
  48149. "parameters": {
  48150. },
  48151. "attributes": {
  48152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48153. },
  48154. "port_directions": {
  48155. "CI": "input",
  48156. "CO": "output",
  48157. "I0": "input",
  48158. "I1": "input"
  48159. },
  48160. "connections": {
  48161. "CI": [ 2005 ],
  48162. "CO": [ 2018 ],
  48163. "I0": [ 1505 ],
  48164. "I1": [ 2004 ]
  48165. }
  48166. },
  48167. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_4": {
  48168. "hide_name": 0,
  48169. "type": "SB_LUT4",
  48170. "parameters": {
  48171. "LUT_INIT": "0110100110010110"
  48172. },
  48173. "attributes": {
  48174. "module_not_derived": "00000000000000000000000000000001",
  48175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48176. },
  48177. "port_directions": {
  48178. "I0": "input",
  48179. "I1": "input",
  48180. "I2": "input",
  48181. "I3": "input",
  48182. "O": "output"
  48183. },
  48184. "connections": {
  48185. "I0": [ "0" ],
  48186. "I1": [ 1501 ],
  48187. "I2": [ 2019 ],
  48188. "I3": [ 2020 ],
  48189. "O": [ 1939 ]
  48190. }
  48191. },
  48192. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_4_I2_SB_LUT4_O": {
  48193. "hide_name": 0,
  48194. "type": "SB_LUT4",
  48195. "parameters": {
  48196. "LUT_INIT": "1111000011001100"
  48197. },
  48198. "attributes": {
  48199. "module_not_derived": "00000000000000000000000000000001",
  48200. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48201. },
  48202. "port_directions": {
  48203. "I0": "input",
  48204. "I1": "input",
  48205. "I2": "input",
  48206. "I3": "input",
  48207. "O": "output"
  48208. },
  48209. "connections": {
  48210. "I0": [ "0" ],
  48211. "I1": [ 1821 ],
  48212. "I2": [ 1536 ],
  48213. "I3": [ 1994 ],
  48214. "O": [ 2019 ]
  48215. }
  48216. },
  48217. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  48218. "hide_name": 0,
  48219. "type": "SB_CARRY",
  48220. "parameters": {
  48221. },
  48222. "attributes": {
  48223. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48224. },
  48225. "port_directions": {
  48226. "CI": "input",
  48227. "CO": "output",
  48228. "I0": "input",
  48229. "I1": "input"
  48230. },
  48231. "connections": {
  48232. "CI": [ 2018 ],
  48233. "CO": [ 2020 ],
  48234. "I0": [ 1503 ],
  48235. "I1": [ 2017 ]
  48236. }
  48237. },
  48238. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_5": {
  48239. "hide_name": 0,
  48240. "type": "SB_LUT4",
  48241. "parameters": {
  48242. "LUT_INIT": "0110100110010110"
  48243. },
  48244. "attributes": {
  48245. "module_not_derived": "00000000000000000000000000000001",
  48246. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48247. },
  48248. "port_directions": {
  48249. "I0": "input",
  48250. "I1": "input",
  48251. "I2": "input",
  48252. "I3": "input",
  48253. "O": "output"
  48254. },
  48255. "connections": {
  48256. "I0": [ "0" ],
  48257. "I1": [ 1499 ],
  48258. "I2": [ 2021 ],
  48259. "I3": [ 2022 ],
  48260. "O": [ 1946 ]
  48261. }
  48262. },
  48263. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_5_I2_SB_LUT4_O": {
  48264. "hide_name": 0,
  48265. "type": "SB_LUT4",
  48266. "parameters": {
  48267. "LUT_INIT": "1111000011001100"
  48268. },
  48269. "attributes": {
  48270. "module_not_derived": "00000000000000000000000000000001",
  48271. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48272. },
  48273. "port_directions": {
  48274. "I0": "input",
  48275. "I1": "input",
  48276. "I2": "input",
  48277. "I3": "input",
  48278. "O": "output"
  48279. },
  48280. "connections": {
  48281. "I0": [ "0" ],
  48282. "I1": [ 1821 ],
  48283. "I2": [ 1535 ],
  48284. "I3": [ 1994 ],
  48285. "O": [ 2021 ]
  48286. }
  48287. },
  48288. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  48289. "hide_name": 0,
  48290. "type": "SB_CARRY",
  48291. "parameters": {
  48292. },
  48293. "attributes": {
  48294. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48295. },
  48296. "port_directions": {
  48297. "CI": "input",
  48298. "CO": "output",
  48299. "I0": "input",
  48300. "I1": "input"
  48301. },
  48302. "connections": {
  48303. "CI": [ 2020 ],
  48304. "CO": [ 2022 ],
  48305. "I0": [ 1501 ],
  48306. "I1": [ 2019 ]
  48307. }
  48308. },
  48309. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_6": {
  48310. "hide_name": 0,
  48311. "type": "SB_LUT4",
  48312. "parameters": {
  48313. "LUT_INIT": "0110100110010110"
  48314. },
  48315. "attributes": {
  48316. "module_not_derived": "00000000000000000000000000000001",
  48317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48318. },
  48319. "port_directions": {
  48320. "I0": "input",
  48321. "I1": "input",
  48322. "I2": "input",
  48323. "I3": "input",
  48324. "O": "output"
  48325. },
  48326. "connections": {
  48327. "I0": [ "0" ],
  48328. "I1": [ 1497 ],
  48329. "I2": [ 2023 ],
  48330. "I3": [ 2024 ],
  48331. "O": [ 1953 ]
  48332. }
  48333. },
  48334. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_6_I2_SB_LUT4_O": {
  48335. "hide_name": 0,
  48336. "type": "SB_LUT4",
  48337. "parameters": {
  48338. "LUT_INIT": "1111000011001100"
  48339. },
  48340. "attributes": {
  48341. "module_not_derived": "00000000000000000000000000000001",
  48342. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48343. },
  48344. "port_directions": {
  48345. "I0": "input",
  48346. "I1": "input",
  48347. "I2": "input",
  48348. "I3": "input",
  48349. "O": "output"
  48350. },
  48351. "connections": {
  48352. "I0": [ "0" ],
  48353. "I1": [ 1821 ],
  48354. "I2": [ 1534 ],
  48355. "I3": [ 1994 ],
  48356. "O": [ 2023 ]
  48357. }
  48358. },
  48359. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  48360. "hide_name": 0,
  48361. "type": "SB_CARRY",
  48362. "parameters": {
  48363. },
  48364. "attributes": {
  48365. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48366. },
  48367. "port_directions": {
  48368. "CI": "input",
  48369. "CO": "output",
  48370. "I0": "input",
  48371. "I1": "input"
  48372. },
  48373. "connections": {
  48374. "CI": [ 2022 ],
  48375. "CO": [ 2024 ],
  48376. "I0": [ 1499 ],
  48377. "I1": [ 2021 ]
  48378. }
  48379. },
  48380. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_7": {
  48381. "hide_name": 0,
  48382. "type": "SB_LUT4",
  48383. "parameters": {
  48384. "LUT_INIT": "0110100110010110"
  48385. },
  48386. "attributes": {
  48387. "module_not_derived": "00000000000000000000000000000001",
  48388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48389. },
  48390. "port_directions": {
  48391. "I0": "input",
  48392. "I1": "input",
  48393. "I2": "input",
  48394. "I3": "input",
  48395. "O": "output"
  48396. },
  48397. "connections": {
  48398. "I0": [ "0" ],
  48399. "I1": [ 1495 ],
  48400. "I2": [ 2025 ],
  48401. "I3": [ 2026 ],
  48402. "O": [ 1960 ]
  48403. }
  48404. },
  48405. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_7_I2_SB_LUT4_O": {
  48406. "hide_name": 0,
  48407. "type": "SB_LUT4",
  48408. "parameters": {
  48409. "LUT_INIT": "1111000011001100"
  48410. },
  48411. "attributes": {
  48412. "module_not_derived": "00000000000000000000000000000001",
  48413. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48414. },
  48415. "port_directions": {
  48416. "I0": "input",
  48417. "I1": "input",
  48418. "I2": "input",
  48419. "I3": "input",
  48420. "O": "output"
  48421. },
  48422. "connections": {
  48423. "I0": [ "0" ],
  48424. "I1": [ 1821 ],
  48425. "I2": [ 1533 ],
  48426. "I3": [ 1994 ],
  48427. "O": [ 2025 ]
  48428. }
  48429. },
  48430. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  48431. "hide_name": 0,
  48432. "type": "SB_CARRY",
  48433. "parameters": {
  48434. },
  48435. "attributes": {
  48436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48437. },
  48438. "port_directions": {
  48439. "CI": "input",
  48440. "CO": "output",
  48441. "I0": "input",
  48442. "I1": "input"
  48443. },
  48444. "connections": {
  48445. "CI": [ 2024 ],
  48446. "CO": [ 2026 ],
  48447. "I0": [ 1497 ],
  48448. "I1": [ 2023 ]
  48449. }
  48450. },
  48451. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_8": {
  48452. "hide_name": 0,
  48453. "type": "SB_LUT4",
  48454. "parameters": {
  48455. "LUT_INIT": "0110100110010110"
  48456. },
  48457. "attributes": {
  48458. "module_not_derived": "00000000000000000000000000000001",
  48459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48460. },
  48461. "port_directions": {
  48462. "I0": "input",
  48463. "I1": "input",
  48464. "I2": "input",
  48465. "I3": "input",
  48466. "O": "output"
  48467. },
  48468. "connections": {
  48469. "I0": [ "0" ],
  48470. "I1": [ 1493 ],
  48471. "I2": [ 2027 ],
  48472. "I3": [ 2028 ],
  48473. "O": [ 1967 ]
  48474. }
  48475. },
  48476. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_8_I2_SB_LUT4_O": {
  48477. "hide_name": 0,
  48478. "type": "SB_LUT4",
  48479. "parameters": {
  48480. "LUT_INIT": "1111000011001100"
  48481. },
  48482. "attributes": {
  48483. "module_not_derived": "00000000000000000000000000000001",
  48484. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48485. },
  48486. "port_directions": {
  48487. "I0": "input",
  48488. "I1": "input",
  48489. "I2": "input",
  48490. "I3": "input",
  48491. "O": "output"
  48492. },
  48493. "connections": {
  48494. "I0": [ "0" ],
  48495. "I1": [ 1821 ],
  48496. "I2": [ 1532 ],
  48497. "I3": [ 1994 ],
  48498. "O": [ 2027 ]
  48499. }
  48500. },
  48501. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  48502. "hide_name": 0,
  48503. "type": "SB_CARRY",
  48504. "parameters": {
  48505. },
  48506. "attributes": {
  48507. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48508. },
  48509. "port_directions": {
  48510. "CI": "input",
  48511. "CO": "output",
  48512. "I0": "input",
  48513. "I1": "input"
  48514. },
  48515. "connections": {
  48516. "CI": [ 2026 ],
  48517. "CO": [ 2028 ],
  48518. "I0": [ 1495 ],
  48519. "I1": [ 2025 ]
  48520. }
  48521. },
  48522. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_9": {
  48523. "hide_name": 0,
  48524. "type": "SB_LUT4",
  48525. "parameters": {
  48526. "LUT_INIT": "0110100110010110"
  48527. },
  48528. "attributes": {
  48529. "module_not_derived": "00000000000000000000000000000001",
  48530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  48531. },
  48532. "port_directions": {
  48533. "I0": "input",
  48534. "I1": "input",
  48535. "I2": "input",
  48536. "I3": "input",
  48537. "O": "output"
  48538. },
  48539. "connections": {
  48540. "I0": [ "0" ],
  48541. "I1": [ 1491 ],
  48542. "I2": [ 1992 ],
  48543. "I3": [ 1991 ],
  48544. "O": [ 1974 ]
  48545. }
  48546. },
  48547. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_9_I2_SB_LUT4_O": {
  48548. "hide_name": 0,
  48549. "type": "SB_LUT4",
  48550. "parameters": {
  48551. "LUT_INIT": "1111000011001100"
  48552. },
  48553. "attributes": {
  48554. "module_not_derived": "00000000000000000000000000000001",
  48555. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48556. },
  48557. "port_directions": {
  48558. "I0": "input",
  48559. "I1": "input",
  48560. "I2": "input",
  48561. "I3": "input",
  48562. "O": "output"
  48563. },
  48564. "connections": {
  48565. "I0": [ "0" ],
  48566. "I1": [ 1821 ],
  48567. "I2": [ 1531 ],
  48568. "I3": [ 1994 ],
  48569. "O": [ 1992 ]
  48570. }
  48571. },
  48572. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  48573. "hide_name": 0,
  48574. "type": "SB_CARRY",
  48575. "parameters": {
  48576. },
  48577. "attributes": {
  48578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48579. },
  48580. "port_directions": {
  48581. "CI": "input",
  48582. "CO": "output",
  48583. "I0": "input",
  48584. "I1": "input"
  48585. },
  48586. "connections": {
  48587. "CI": [ 2028 ],
  48588. "CO": [ 1991 ],
  48589. "I0": [ 1493 ],
  48590. "I1": [ 2027 ]
  48591. }
  48592. },
  48593. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_I3_SB_CARRY_CO": {
  48594. "hide_name": 0,
  48595. "type": "SB_CARRY",
  48596. "parameters": {
  48597. },
  48598. "attributes": {
  48599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  48600. },
  48601. "port_directions": {
  48602. "CI": "input",
  48603. "CO": "output",
  48604. "I0": "input",
  48605. "I1": "input"
  48606. },
  48607. "connections": {
  48608. "CI": [ 2007 ],
  48609. "CO": [ 1987 ],
  48610. "I0": [ 1485 ],
  48611. "I1": [ 1821 ]
  48612. }
  48613. },
  48614. "cpu_I.RegFilePlugin_regFile.0.0": {
  48615. "hide_name": 0,
  48616. "type": "SB_RAM40_4K",
  48617. "parameters": {
  48618. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48619. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48620. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48621. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48622. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48623. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48624. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48625. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48626. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48627. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48628. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48629. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48630. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48631. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48632. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48633. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  48634. "READ_MODE": "00",
  48635. "WRITE_MODE": "00"
  48636. },
  48637. "attributes": {
  48638. "module_not_derived": "00000000000000000000000000000001",
  48639. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  48640. },
  48641. "port_directions": {
  48642. "MASK": "input",
  48643. "RADDR": "input",
  48644. "RCLK": "input",
  48645. "RCLKE": "input",
  48646. "RDATA": "output",
  48647. "RE": "input",
  48648. "WADDR": "input",
  48649. "WCLK": "input",
  48650. "WCLKE": "input",
  48651. "WDATA": "input",
  48652. "WE": "input"
  48653. },
  48654. "connections": {
  48655. "MASK": [ 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029 ],
  48656. "RADDR": [ 2030, 2031, 2032, 2033, 2034, 2035, "0", "0", "0", "0", "0" ],
  48657. "RCLK": [ 42 ],
  48658. "RCLKE": [ "1" ],
  48659. "RDATA": [ 2036, 2037, 2038, 2039, 2040, 2041, 2042, 2043, 2044, 2045, 2046, 2047, 2048, 2049, 2050, 2051 ],
  48660. "RE": [ "1" ],
  48661. "WADDR": [ 2052, 2053, 2054, 2055, 2056, 2057, "0", "0", "0", "0", "0" ],
  48662. "WCLK": [ 42 ],
  48663. "WCLKE": [ 2058 ],
  48664. "WDATA": [ 2059, 2060, 2061, 2062, 2063, 2064, 2065, 2066, 2067, 2068, 2069, 2070, 2071, 2072, 2073, 2074 ],
  48665. "WE": [ "1" ]
  48666. }
  48667. },
  48668. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_1_SB_LUT4_O": {
  48669. "hide_name": 0,
  48670. "type": "SB_LUT4",
  48671. "parameters": {
  48672. "LUT_INIT": "1111000011001100"
  48673. },
  48674. "attributes": {
  48675. "module_not_derived": "00000000000000000000000000000001",
  48676. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48677. },
  48678. "port_directions": {
  48679. "I0": "input",
  48680. "I1": "input",
  48681. "I2": "input",
  48682. "I3": "input",
  48683. "O": "output"
  48684. },
  48685. "connections": {
  48686. "I0": [ "0" ],
  48687. "I1": [ 1550 ],
  48688. "I2": [ 1304 ],
  48689. "I3": [ 1475 ],
  48690. "O": [ 2033 ]
  48691. }
  48692. },
  48693. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_1_SB_LUT4_O_1": {
  48694. "hide_name": 0,
  48695. "type": "SB_LUT4",
  48696. "parameters": {
  48697. "LUT_INIT": "1111000011001100"
  48698. },
  48699. "attributes": {
  48700. "module_not_derived": "00000000000000000000000000000001",
  48701. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48702. },
  48703. "port_directions": {
  48704. "I0": "input",
  48705. "I1": "input",
  48706. "I2": "input",
  48707. "I3": "input",
  48708. "O": "output"
  48709. },
  48710. "connections": {
  48711. "I0": [ "0" ],
  48712. "I1": [ 1530 ],
  48713. "I2": [ 1313 ],
  48714. "I3": [ 1475 ],
  48715. "O": [ 2030 ]
  48716. }
  48717. },
  48718. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_2_SB_LUT4_O": {
  48719. "hide_name": 0,
  48720. "type": "SB_LUT4",
  48721. "parameters": {
  48722. "LUT_INIT": "1111000011001100"
  48723. },
  48724. "attributes": {
  48725. "module_not_derived": "00000000000000000000000000000001",
  48726. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48727. },
  48728. "port_directions": {
  48729. "I0": "input",
  48730. "I1": "input",
  48731. "I2": "input",
  48732. "I3": "input",
  48733. "O": "output"
  48734. },
  48735. "connections": {
  48736. "I0": [ "0" ],
  48737. "I1": [ 1551 ],
  48738. "I2": [ 1307 ],
  48739. "I3": [ 1475 ],
  48740. "O": [ 2032 ]
  48741. }
  48742. },
  48743. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_2_SB_LUT4_O_1": {
  48744. "hide_name": 0,
  48745. "type": "SB_LUT4",
  48746. "parameters": {
  48747. "LUT_INIT": "1111000011001100"
  48748. },
  48749. "attributes": {
  48750. "module_not_derived": "00000000000000000000000000000001",
  48751. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48752. },
  48753. "port_directions": {
  48754. "I0": "input",
  48755. "I1": "input",
  48756. "I2": "input",
  48757. "I3": "input",
  48758. "O": "output"
  48759. },
  48760. "connections": {
  48761. "I0": [ "0" ],
  48762. "I1": [ 1552 ],
  48763. "I2": [ 1310 ],
  48764. "I3": [ 1475 ],
  48765. "O": [ 2031 ]
  48766. }
  48767. },
  48768. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_SB_LUT4_O": {
  48769. "hide_name": 0,
  48770. "type": "SB_LUT4",
  48771. "parameters": {
  48772. "LUT_INIT": "1111000011001100"
  48773. },
  48774. "attributes": {
  48775. "module_not_derived": "00000000000000000000000000000001",
  48776. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48777. },
  48778. "port_directions": {
  48779. "I0": "input",
  48780. "I1": "input",
  48781. "I2": "input",
  48782. "I3": "input",
  48783. "O": "output"
  48784. },
  48785. "connections": {
  48786. "I0": [ "0" ],
  48787. "I1": [ 1549 ],
  48788. "I2": [ 1301 ],
  48789. "I3": [ 1475 ],
  48790. "O": [ 2034 ]
  48791. }
  48792. },
  48793. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_SB_LUT4_O_1": {
  48794. "hide_name": 0,
  48795. "type": "SB_LUT4",
  48796. "parameters": {
  48797. "LUT_INIT": "0000111100000000"
  48798. },
  48799. "attributes": {
  48800. "module_not_derived": "00000000000000000000000000000001",
  48801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  48802. },
  48803. "port_directions": {
  48804. "I0": "input",
  48805. "I1": "input",
  48806. "I2": "input",
  48807. "I3": "input",
  48808. "O": "output"
  48809. },
  48810. "connections": {
  48811. "I0": [ "0" ],
  48812. "I1": [ "0" ],
  48813. "I2": [ 2053 ],
  48814. "I3": [ 2031 ],
  48815. "O": [ 2075 ]
  48816. }
  48817. },
  48818. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_10_SB_DFF_Q": {
  48819. "hide_name": 0,
  48820. "type": "SB_DFF",
  48821. "parameters": {
  48822. },
  48823. "attributes": {
  48824. "module_not_derived": "00000000000000000000000000000001",
  48825. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  48826. },
  48827. "port_directions": {
  48828. "C": "input",
  48829. "D": "input",
  48830. "Q": "output"
  48831. },
  48832. "connections": {
  48833. "C": [ 42 ],
  48834. "D": [ 2064 ],
  48835. "Q": [ 2076 ]
  48836. }
  48837. },
  48838. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_11_SB_LUT4_I1": {
  48839. "hide_name": 0,
  48840. "type": "SB_LUT4",
  48841. "parameters": {
  48842. "LUT_INIT": "0000111100110011"
  48843. },
  48844. "attributes": {
  48845. "module_not_derived": "00000000000000000000000000000001",
  48846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48847. },
  48848. "port_directions": {
  48849. "I0": "input",
  48850. "I1": "input",
  48851. "I2": "input",
  48852. "I3": "input",
  48853. "O": "output"
  48854. },
  48855. "connections": {
  48856. "I0": [ "0" ],
  48857. "I1": [ 2040 ],
  48858. "I2": [ 2077 ],
  48859. "I3": [ 2078 ],
  48860. "O": [ 2079 ]
  48861. }
  48862. },
  48863. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_11_SB_LUT4_I1_O_SB_LUT4_I2": {
  48864. "hide_name": 0,
  48865. "type": "SB_LUT4",
  48866. "parameters": {
  48867. "LUT_INIT": "1100110000001111"
  48868. },
  48869. "attributes": {
  48870. "module_not_derived": "00000000000000000000000000000001",
  48871. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48872. },
  48873. "port_directions": {
  48874. "I0": "input",
  48875. "I1": "input",
  48876. "I2": "input",
  48877. "I3": "input",
  48878. "O": "output"
  48879. },
  48880. "connections": {
  48881. "I0": [ "0" ],
  48882. "I1": [ 2063 ],
  48883. "I2": [ 2079 ],
  48884. "I3": [ 2080 ],
  48885. "O": [ 2081 ]
  48886. }
  48887. },
  48888. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_12_SB_DFF_Q": {
  48889. "hide_name": 0,
  48890. "type": "SB_DFF",
  48891. "parameters": {
  48892. },
  48893. "attributes": {
  48894. "module_not_derived": "00000000000000000000000000000001",
  48895. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  48896. },
  48897. "port_directions": {
  48898. "C": "input",
  48899. "D": "input",
  48900. "Q": "output"
  48901. },
  48902. "connections": {
  48903. "C": [ 42 ],
  48904. "D": [ 2062 ],
  48905. "Q": [ 2082 ]
  48906. }
  48907. },
  48908. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_13_SB_LUT4_I1": {
  48909. "hide_name": 0,
  48910. "type": "SB_LUT4",
  48911. "parameters": {
  48912. "LUT_INIT": "0000111100110011"
  48913. },
  48914. "attributes": {
  48915. "module_not_derived": "00000000000000000000000000000001",
  48916. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48917. },
  48918. "port_directions": {
  48919. "I0": "input",
  48920. "I1": "input",
  48921. "I2": "input",
  48922. "I3": "input",
  48923. "O": "output"
  48924. },
  48925. "connections": {
  48926. "I0": [ "0" ],
  48927. "I1": [ 2038 ],
  48928. "I2": [ 2083 ],
  48929. "I3": [ 2078 ],
  48930. "O": [ 2084 ]
  48931. }
  48932. },
  48933. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_13_SB_LUT4_I1_O_SB_LUT4_I2": {
  48934. "hide_name": 0,
  48935. "type": "SB_LUT4",
  48936. "parameters": {
  48937. "LUT_INIT": "1100110000001111"
  48938. },
  48939. "attributes": {
  48940. "module_not_derived": "00000000000000000000000000000001",
  48941. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  48942. },
  48943. "port_directions": {
  48944. "I0": "input",
  48945. "I1": "input",
  48946. "I2": "input",
  48947. "I3": "input",
  48948. "O": "output"
  48949. },
  48950. "connections": {
  48951. "I0": [ "0" ],
  48952. "I1": [ 2061 ],
  48953. "I2": [ 2084 ],
  48954. "I3": [ 2080 ],
  48955. "O": [ 2085 ]
  48956. }
  48957. },
  48958. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_14_SB_DFF_Q": {
  48959. "hide_name": 0,
  48960. "type": "SB_DFF",
  48961. "parameters": {
  48962. },
  48963. "attributes": {
  48964. "module_not_derived": "00000000000000000000000000000001",
  48965. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  48966. },
  48967. "port_directions": {
  48968. "C": "input",
  48969. "D": "input",
  48970. "Q": "output"
  48971. },
  48972. "connections": {
  48973. "C": [ 42 ],
  48974. "D": [ 2060 ],
  48975. "Q": [ 2086 ]
  48976. }
  48977. },
  48978. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_15_SB_DFF_Q": {
  48979. "hide_name": 0,
  48980. "type": "SB_DFF",
  48981. "parameters": {
  48982. },
  48983. "attributes": {
  48984. "module_not_derived": "00000000000000000000000000000001",
  48985. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  48986. },
  48987. "port_directions": {
  48988. "C": "input",
  48989. "D": "input",
  48990. "Q": "output"
  48991. },
  48992. "connections": {
  48993. "C": [ 42 ],
  48994. "D": [ 2059 ],
  48995. "Q": [ 2087 ]
  48996. }
  48997. },
  48998. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_15_SB_LUT4_I2": {
  48999. "hide_name": 0,
  49000. "type": "SB_LUT4",
  49001. "parameters": {
  49002. "LUT_INIT": "0000111100110011"
  49003. },
  49004. "attributes": {
  49005. "module_not_derived": "00000000000000000000000000000001",
  49006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49007. },
  49008. "port_directions": {
  49009. "I0": "input",
  49010. "I1": "input",
  49011. "I2": "input",
  49012. "I3": "input",
  49013. "O": "output"
  49014. },
  49015. "connections": {
  49016. "I0": [ "0" ],
  49017. "I1": [ 2088 ],
  49018. "I2": [ 2087 ],
  49019. "I3": [ 2089 ],
  49020. "O": [ 2090 ]
  49021. }
  49022. },
  49023. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_15_SB_LUT4_I2_O_SB_LUT4_O": {
  49024. "hide_name": 0,
  49025. "type": "SB_LUT4",
  49026. "parameters": {
  49027. "LUT_INIT": "1100000000000000"
  49028. },
  49029. "attributes": {
  49030. "module_not_derived": "00000000000000000000000000000001",
  49031. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49032. },
  49033. "port_directions": {
  49034. "I0": "input",
  49035. "I1": "input",
  49036. "I2": "input",
  49037. "I3": "input",
  49038. "O": "output"
  49039. },
  49040. "connections": {
  49041. "I0": [ "0" ],
  49042. "I1": [ 2091 ],
  49043. "I2": [ 2092 ],
  49044. "I3": [ 2093 ],
  49045. "O": [ 2094 ]
  49046. }
  49047. },
  49048. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_1_SB_LUT4_I1": {
  49049. "hide_name": 0,
  49050. "type": "SB_LUT4",
  49051. "parameters": {
  49052. "LUT_INIT": "1111000011001100"
  49053. },
  49054. "attributes": {
  49055. "module_not_derived": "00000000000000000000000000000001",
  49056. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49057. },
  49058. "port_directions": {
  49059. "I0": "input",
  49060. "I1": "input",
  49061. "I2": "input",
  49062. "I3": "input",
  49063. "O": "output"
  49064. },
  49065. "connections": {
  49066. "I0": [ "0" ],
  49067. "I1": [ 2050 ],
  49068. "I2": [ 2095 ],
  49069. "I3": [ 2078 ],
  49070. "O": [ 2096 ]
  49071. }
  49072. },
  49073. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_1_SB_LUT4_I1_O_SB_LUT4_I2": {
  49074. "hide_name": 0,
  49075. "type": "SB_LUT4",
  49076. "parameters": {
  49077. "LUT_INIT": "1100110011110000"
  49078. },
  49079. "attributes": {
  49080. "module_not_derived": "00000000000000000000000000000001",
  49081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49082. },
  49083. "port_directions": {
  49084. "I0": "input",
  49085. "I1": "input",
  49086. "I2": "input",
  49087. "I3": "input",
  49088. "O": "output"
  49089. },
  49090. "connections": {
  49091. "I0": [ "0" ],
  49092. "I1": [ 2073 ],
  49093. "I2": [ 2096 ],
  49094. "I3": [ 2080 ],
  49095. "O": [ 2097 ]
  49096. }
  49097. },
  49098. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_2_SB_LUT4_I1": {
  49099. "hide_name": 0,
  49100. "type": "SB_LUT4",
  49101. "parameters": {
  49102. "LUT_INIT": "1111000011001100"
  49103. },
  49104. "attributes": {
  49105. "module_not_derived": "00000000000000000000000000000001",
  49106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49107. },
  49108. "port_directions": {
  49109. "I0": "input",
  49110. "I1": "input",
  49111. "I2": "input",
  49112. "I3": "input",
  49113. "O": "output"
  49114. },
  49115. "connections": {
  49116. "I0": [ "0" ],
  49117. "I1": [ 2049 ],
  49118. "I2": [ 2098 ],
  49119. "I3": [ 2078 ],
  49120. "O": [ 2099 ]
  49121. }
  49122. },
  49123. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_2_SB_LUT4_I1_O_SB_LUT4_I2": {
  49124. "hide_name": 0,
  49125. "type": "SB_LUT4",
  49126. "parameters": {
  49127. "LUT_INIT": "1100110011110000"
  49128. },
  49129. "attributes": {
  49130. "module_not_derived": "00000000000000000000000000000001",
  49131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49132. },
  49133. "port_directions": {
  49134. "I0": "input",
  49135. "I1": "input",
  49136. "I2": "input",
  49137. "I3": "input",
  49138. "O": "output"
  49139. },
  49140. "connections": {
  49141. "I0": [ "0" ],
  49142. "I1": [ 2072 ],
  49143. "I2": [ 2099 ],
  49144. "I3": [ 2080 ],
  49145. "O": [ 2100 ]
  49146. }
  49147. },
  49148. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_3_SB_LUT4_I1": {
  49149. "hide_name": 0,
  49150. "type": "SB_LUT4",
  49151. "parameters": {
  49152. "LUT_INIT": "0000111100110011"
  49153. },
  49154. "attributes": {
  49155. "module_not_derived": "00000000000000000000000000000001",
  49156. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49157. },
  49158. "port_directions": {
  49159. "I0": "input",
  49160. "I1": "input",
  49161. "I2": "input",
  49162. "I3": "input",
  49163. "O": "output"
  49164. },
  49165. "connections": {
  49166. "I0": [ "0" ],
  49167. "I1": [ 2048 ],
  49168. "I2": [ 2101 ],
  49169. "I3": [ 2078 ],
  49170. "O": [ 2102 ]
  49171. }
  49172. },
  49173. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_3_SB_LUT4_I1_O_SB_LUT4_I2": {
  49174. "hide_name": 0,
  49175. "type": "SB_LUT4",
  49176. "parameters": {
  49177. "LUT_INIT": "1100110000001111"
  49178. },
  49179. "attributes": {
  49180. "module_not_derived": "00000000000000000000000000000001",
  49181. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49182. },
  49183. "port_directions": {
  49184. "I0": "input",
  49185. "I1": "input",
  49186. "I2": "input",
  49187. "I3": "input",
  49188. "O": "output"
  49189. },
  49190. "connections": {
  49191. "I0": [ "0" ],
  49192. "I1": [ 2071 ],
  49193. "I2": [ 2102 ],
  49194. "I3": [ 2080 ],
  49195. "O": [ 2103 ]
  49196. }
  49197. },
  49198. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_4_SB_LUT4_I1": {
  49199. "hide_name": 0,
  49200. "type": "SB_LUT4",
  49201. "parameters": {
  49202. "LUT_INIT": "1111000011001100"
  49203. },
  49204. "attributes": {
  49205. "module_not_derived": "00000000000000000000000000000001",
  49206. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49207. },
  49208. "port_directions": {
  49209. "I0": "input",
  49210. "I1": "input",
  49211. "I2": "input",
  49212. "I3": "input",
  49213. "O": "output"
  49214. },
  49215. "connections": {
  49216. "I0": [ "0" ],
  49217. "I1": [ 2047 ],
  49218. "I2": [ 2104 ],
  49219. "I3": [ 2078 ],
  49220. "O": [ 2105 ]
  49221. }
  49222. },
  49223. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I2": {
  49224. "hide_name": 0,
  49225. "type": "SB_LUT4",
  49226. "parameters": {
  49227. "LUT_INIT": "1100110011110000"
  49228. },
  49229. "attributes": {
  49230. "module_not_derived": "00000000000000000000000000000001",
  49231. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49232. },
  49233. "port_directions": {
  49234. "I0": "input",
  49235. "I1": "input",
  49236. "I2": "input",
  49237. "I3": "input",
  49238. "O": "output"
  49239. },
  49240. "connections": {
  49241. "I0": [ "0" ],
  49242. "I1": [ 2070 ],
  49243. "I2": [ 2105 ],
  49244. "I3": [ 2080 ],
  49245. "O": [ 2106 ]
  49246. }
  49247. },
  49248. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_5_SB_LUT4_I1": {
  49249. "hide_name": 0,
  49250. "type": "SB_LUT4",
  49251. "parameters": {
  49252. "LUT_INIT": "0000111100110011"
  49253. },
  49254. "attributes": {
  49255. "module_not_derived": "00000000000000000000000000000001",
  49256. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49257. },
  49258. "port_directions": {
  49259. "I0": "input",
  49260. "I1": "input",
  49261. "I2": "input",
  49262. "I3": "input",
  49263. "O": "output"
  49264. },
  49265. "connections": {
  49266. "I0": [ "0" ],
  49267. "I1": [ 2046 ],
  49268. "I2": [ 2107 ],
  49269. "I3": [ 2078 ],
  49270. "O": [ 2108 ]
  49271. }
  49272. },
  49273. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2": {
  49274. "hide_name": 0,
  49275. "type": "SB_LUT4",
  49276. "parameters": {
  49277. "LUT_INIT": "1100110000001111"
  49278. },
  49279. "attributes": {
  49280. "module_not_derived": "00000000000000000000000000000001",
  49281. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49282. },
  49283. "port_directions": {
  49284. "I0": "input",
  49285. "I1": "input",
  49286. "I2": "input",
  49287. "I3": "input",
  49288. "O": "output"
  49289. },
  49290. "connections": {
  49291. "I0": [ "0" ],
  49292. "I1": [ 2069 ],
  49293. "I2": [ 2108 ],
  49294. "I3": [ 2080 ],
  49295. "O": [ 2109 ]
  49296. }
  49297. },
  49298. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_6_SB_LUT4_I1": {
  49299. "hide_name": 0,
  49300. "type": "SB_LUT4",
  49301. "parameters": {
  49302. "LUT_INIT": "1111000011001100"
  49303. },
  49304. "attributes": {
  49305. "module_not_derived": "00000000000000000000000000000001",
  49306. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49307. },
  49308. "port_directions": {
  49309. "I0": "input",
  49310. "I1": "input",
  49311. "I2": "input",
  49312. "I3": "input",
  49313. "O": "output"
  49314. },
  49315. "connections": {
  49316. "I0": [ "0" ],
  49317. "I1": [ 2045 ],
  49318. "I2": [ 2110 ],
  49319. "I3": [ 2078 ],
  49320. "O": [ 2111 ]
  49321. }
  49322. },
  49323. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_6_SB_LUT4_I1_O_SB_LUT4_I1": {
  49324. "hide_name": 0,
  49325. "type": "SB_LUT4",
  49326. "parameters": {
  49327. "LUT_INIT": "0000010100000011"
  49328. },
  49329. "attributes": {
  49330. "module_not_derived": "00000000000000000000000000000001",
  49331. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  49332. },
  49333. "port_directions": {
  49334. "I0": "input",
  49335. "I1": "input",
  49336. "I2": "input",
  49337. "I3": "input",
  49338. "O": "output"
  49339. },
  49340. "connections": {
  49341. "I0": [ 2068 ],
  49342. "I1": [ 2111 ],
  49343. "I2": [ 2112 ],
  49344. "I3": [ 2080 ],
  49345. "O": [ 2113 ]
  49346. }
  49347. },
  49348. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_7_SB_LUT4_I1": {
  49349. "hide_name": 0,
  49350. "type": "SB_LUT4",
  49351. "parameters": {
  49352. "LUT_INIT": "1111000011001100"
  49353. },
  49354. "attributes": {
  49355. "module_not_derived": "00000000000000000000000000000001",
  49356. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49357. },
  49358. "port_directions": {
  49359. "I0": "input",
  49360. "I1": "input",
  49361. "I2": "input",
  49362. "I3": "input",
  49363. "O": "output"
  49364. },
  49365. "connections": {
  49366. "I0": [ "0" ],
  49367. "I1": [ 2044 ],
  49368. "I2": [ 2114 ],
  49369. "I3": [ 2078 ],
  49370. "O": [ 2115 ]
  49371. }
  49372. },
  49373. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I2": {
  49374. "hide_name": 0,
  49375. "type": "SB_LUT4",
  49376. "parameters": {
  49377. "LUT_INIT": "1100110011110000"
  49378. },
  49379. "attributes": {
  49380. "module_not_derived": "00000000000000000000000000000001",
  49381. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49382. },
  49383. "port_directions": {
  49384. "I0": "input",
  49385. "I1": "input",
  49386. "I2": "input",
  49387. "I3": "input",
  49388. "O": "output"
  49389. },
  49390. "connections": {
  49391. "I0": [ "0" ],
  49392. "I1": [ 2067 ],
  49393. "I2": [ 2115 ],
  49394. "I3": [ 2080 ],
  49395. "O": [ 2116 ]
  49396. }
  49397. },
  49398. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_8_SB_LUT4_I1": {
  49399. "hide_name": 0,
  49400. "type": "SB_LUT4",
  49401. "parameters": {
  49402. "LUT_INIT": "1111000011001100"
  49403. },
  49404. "attributes": {
  49405. "module_not_derived": "00000000000000000000000000000001",
  49406. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49407. },
  49408. "port_directions": {
  49409. "I0": "input",
  49410. "I1": "input",
  49411. "I2": "input",
  49412. "I3": "input",
  49413. "O": "output"
  49414. },
  49415. "connections": {
  49416. "I0": [ "0" ],
  49417. "I1": [ 2043 ],
  49418. "I2": [ 2117 ],
  49419. "I3": [ 2078 ],
  49420. "O": [ 2118 ]
  49421. }
  49422. },
  49423. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_8_SB_LUT4_I1_O_SB_LUT4_I2": {
  49424. "hide_name": 0,
  49425. "type": "SB_LUT4",
  49426. "parameters": {
  49427. "LUT_INIT": "1100110011110000"
  49428. },
  49429. "attributes": {
  49430. "module_not_derived": "00000000000000000000000000000001",
  49431. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49432. },
  49433. "port_directions": {
  49434. "I0": "input",
  49435. "I1": "input",
  49436. "I2": "input",
  49437. "I3": "input",
  49438. "O": "output"
  49439. },
  49440. "connections": {
  49441. "I0": [ "0" ],
  49442. "I1": [ 2066 ],
  49443. "I2": [ 2118 ],
  49444. "I3": [ 2080 ],
  49445. "O": [ 2119 ]
  49446. }
  49447. },
  49448. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_9_SB_LUT4_I1": {
  49449. "hide_name": 0,
  49450. "type": "SB_LUT4",
  49451. "parameters": {
  49452. "LUT_INIT": "0000111100110011"
  49453. },
  49454. "attributes": {
  49455. "module_not_derived": "00000000000000000000000000000001",
  49456. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49457. },
  49458. "port_directions": {
  49459. "I0": "input",
  49460. "I1": "input",
  49461. "I2": "input",
  49462. "I3": "input",
  49463. "O": "output"
  49464. },
  49465. "connections": {
  49466. "I0": [ "0" ],
  49467. "I1": [ 2042 ],
  49468. "I2": [ 2120 ],
  49469. "I3": [ 2078 ],
  49470. "O": [ 2121 ]
  49471. }
  49472. },
  49473. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_9_SB_LUT4_I1_O_SB_LUT4_I2": {
  49474. "hide_name": 0,
  49475. "type": "SB_LUT4",
  49476. "parameters": {
  49477. "LUT_INIT": "1100110000001111"
  49478. },
  49479. "attributes": {
  49480. "module_not_derived": "00000000000000000000000000000001",
  49481. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49482. },
  49483. "port_directions": {
  49484. "I0": "input",
  49485. "I1": "input",
  49486. "I2": "input",
  49487. "I3": "input",
  49488. "O": "output"
  49489. },
  49490. "connections": {
  49491. "I0": [ "0" ],
  49492. "I1": [ 2065 ],
  49493. "I2": [ 2121 ],
  49494. "I3": [ 2080 ],
  49495. "O": [ 2122 ]
  49496. }
  49497. },
  49498. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_SB_DFF_Q": {
  49499. "hide_name": 0,
  49500. "type": "SB_DFF",
  49501. "parameters": {
  49502. },
  49503. "attributes": {
  49504. "module_not_derived": "00000000000000000000000000000001",
  49505. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49506. },
  49507. "port_directions": {
  49508. "C": "input",
  49509. "D": "input",
  49510. "Q": "output"
  49511. },
  49512. "connections": {
  49513. "C": [ 42 ],
  49514. "D": [ 2074 ],
  49515. "Q": [ 2123 ]
  49516. }
  49517. },
  49518. "cpu_I.RegFilePlugin_regFile.0.1": {
  49519. "hide_name": 0,
  49520. "type": "SB_RAM40_4K",
  49521. "parameters": {
  49522. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49523. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49524. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49525. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49526. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49527. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49528. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49529. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49530. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49531. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49532. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49533. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49534. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49535. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49536. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49537. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  49538. "READ_MODE": "00",
  49539. "WRITE_MODE": "00"
  49540. },
  49541. "attributes": {
  49542. "module_not_derived": "00000000000000000000000000000001",
  49543. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  49544. },
  49545. "port_directions": {
  49546. "MASK": "input",
  49547. "RADDR": "input",
  49548. "RCLK": "input",
  49549. "RCLKE": "input",
  49550. "RDATA": "output",
  49551. "RE": "input",
  49552. "WADDR": "input",
  49553. "WCLK": "input",
  49554. "WCLKE": "input",
  49555. "WDATA": "input",
  49556. "WE": "input"
  49557. },
  49558. "connections": {
  49559. "MASK": [ 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029 ],
  49560. "RADDR": [ 2030, 2031, 2032, 2033, 2034, 2035, "0", "0", "0", "0", "0" ],
  49561. "RCLK": [ 42 ],
  49562. "RCLKE": [ "1" ],
  49563. "RDATA": [ 2124, 2125, 2126, 2127, 2128, 2129, 2130, 2131, 2132, 2133, 2134, 2135, 2136, 2137, 2138, 2139 ],
  49564. "RE": [ "1" ],
  49565. "WADDR": [ 2052, 2053, 2054, 2055, 2056, 2057, "0", "0", "0", "0", "0" ],
  49566. "WCLK": [ 42 ],
  49567. "WCLKE": [ 2058 ],
  49568. "WDATA": [ 2140, 2141, 2142, 2143, 2144, 2145, 2146, 2147, 2148, 2149, 2150, 2151, 2152, 2153, 2154, 2155 ],
  49569. "WE": [ "1" ]
  49570. }
  49571. },
  49572. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q": {
  49573. "hide_name": 0,
  49574. "type": "SB_DFF",
  49575. "parameters": {
  49576. },
  49577. "attributes": {
  49578. "module_not_derived": "00000000000000000000000000000001",
  49579. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49580. },
  49581. "port_directions": {
  49582. "C": "input",
  49583. "D": "input",
  49584. "Q": "output"
  49585. },
  49586. "connections": {
  49587. "C": [ 42 ],
  49588. "D": [ 2156 ],
  49589. "Q": [ 2078 ]
  49590. }
  49591. },
  49592. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_1": {
  49593. "hide_name": 0,
  49594. "type": "SB_DFF",
  49595. "parameters": {
  49596. },
  49597. "attributes": {
  49598. "module_not_derived": "00000000000000000000000000000001",
  49599. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49600. },
  49601. "port_directions": {
  49602. "C": "input",
  49603. "D": "input",
  49604. "Q": "output"
  49605. },
  49606. "connections": {
  49607. "C": [ 42 ],
  49608. "D": [ 2145 ],
  49609. "Q": [ 2157 ]
  49610. }
  49611. },
  49612. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_D_SB_LUT4_O": {
  49613. "hide_name": 0,
  49614. "type": "SB_LUT4",
  49615. "parameters": {
  49616. "LUT_INIT": "1100000000000000"
  49617. },
  49618. "attributes": {
  49619. "module_not_derived": "00000000000000000000000000000001",
  49620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49621. },
  49622. "port_directions": {
  49623. "I0": "input",
  49624. "I1": "input",
  49625. "I2": "input",
  49626. "I3": "input",
  49627. "O": "output"
  49628. },
  49629. "connections": {
  49630. "I0": [ "0" ],
  49631. "I1": [ 2158 ],
  49632. "I2": [ 2159 ],
  49633. "I3": [ 2160 ],
  49634. "O": [ 2156 ]
  49635. }
  49636. },
  49637. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_D_SB_LUT4_O_I1_SB_LUT4_O": {
  49638. "hide_name": 0,
  49639. "type": "SB_LUT4",
  49640. "parameters": {
  49641. "LUT_INIT": "0000000010000100"
  49642. },
  49643. "attributes": {
  49644. "module_not_derived": "00000000000000000000000000000001",
  49645. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  49646. },
  49647. "port_directions": {
  49648. "I0": "input",
  49649. "I1": "input",
  49650. "I2": "input",
  49651. "I3": "input",
  49652. "O": "output"
  49653. },
  49654. "connections": {
  49655. "I0": [ 2056 ],
  49656. "I1": [ 2161 ],
  49657. "I2": [ 2034 ],
  49658. "I3": [ 2075 ],
  49659. "O": [ 2160 ]
  49660. }
  49661. },
  49662. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_D_SB_LUT4_O_I1_SB_LUT4_O_1": {
  49663. "hide_name": 0,
  49664. "type": "SB_LUT4",
  49665. "parameters": {
  49666. "LUT_INIT": "1000001001000001"
  49667. },
  49668. "attributes": {
  49669. "module_not_derived": "00000000000000000000000000000001",
  49670. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  49671. },
  49672. "port_directions": {
  49673. "I0": "input",
  49674. "I1": "input",
  49675. "I2": "input",
  49676. "I3": "input",
  49677. "O": "output"
  49678. },
  49679. "connections": {
  49680. "I0": [ 2055 ],
  49681. "I1": [ 2052 ],
  49682. "I2": [ 2030 ],
  49683. "I3": [ 2033 ],
  49684. "O": [ 2158 ]
  49685. }
  49686. },
  49687. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_D_SB_LUT4_O_I1_SB_LUT4_O_2": {
  49688. "hide_name": 0,
  49689. "type": "SB_LUT4",
  49690. "parameters": {
  49691. "LUT_INIT": "1010001001010001"
  49692. },
  49693. "attributes": {
  49694. "module_not_derived": "00000000000000000000000000000001",
  49695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  49696. },
  49697. "port_directions": {
  49698. "I0": "input",
  49699. "I1": "input",
  49700. "I2": "input",
  49701. "I3": "input",
  49702. "O": "output"
  49703. },
  49704. "connections": {
  49705. "I0": [ 2054 ],
  49706. "I1": [ 2053 ],
  49707. "I2": [ 2031 ],
  49708. "I3": [ 2032 ],
  49709. "O": [ 2159 ]
  49710. }
  49711. },
  49712. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_11_SB_DFF_Q": {
  49713. "hide_name": 0,
  49714. "type": "SB_DFF",
  49715. "parameters": {
  49716. },
  49717. "attributes": {
  49718. "module_not_derived": "00000000000000000000000000000001",
  49719. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49720. },
  49721. "port_directions": {
  49722. "C": "input",
  49723. "D": "input",
  49724. "Q": "output"
  49725. },
  49726. "connections": {
  49727. "C": [ 42 ],
  49728. "D": [ 2144 ],
  49729. "Q": [ 2162 ]
  49730. }
  49731. },
  49732. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_12_SB_DFF_Q": {
  49733. "hide_name": 0,
  49734. "type": "SB_DFF",
  49735. "parameters": {
  49736. },
  49737. "attributes": {
  49738. "module_not_derived": "00000000000000000000000000000001",
  49739. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49740. },
  49741. "port_directions": {
  49742. "C": "input",
  49743. "D": "input",
  49744. "Q": "output"
  49745. },
  49746. "connections": {
  49747. "C": [ 42 ],
  49748. "D": [ 2143 ],
  49749. "Q": [ 2163 ]
  49750. }
  49751. },
  49752. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_13_SB_LUT4_I1": {
  49753. "hide_name": 0,
  49754. "type": "SB_LUT4",
  49755. "parameters": {
  49756. "LUT_INIT": "1111000011001100"
  49757. },
  49758. "attributes": {
  49759. "module_not_derived": "00000000000000000000000000000001",
  49760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49761. },
  49762. "port_directions": {
  49763. "I0": "input",
  49764. "I1": "input",
  49765. "I2": "input",
  49766. "I3": "input",
  49767. "O": "output"
  49768. },
  49769. "connections": {
  49770. "I0": [ "0" ],
  49771. "I1": [ 2126 ],
  49772. "I2": [ 2164 ],
  49773. "I3": [ 2078 ],
  49774. "O": [ 2165 ]
  49775. }
  49776. },
  49777. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_13_SB_LUT4_I1_O_SB_LUT4_I2": {
  49778. "hide_name": 0,
  49779. "type": "SB_LUT4",
  49780. "parameters": {
  49781. "LUT_INIT": "1100110011110000"
  49782. },
  49783. "attributes": {
  49784. "module_not_derived": "00000000000000000000000000000001",
  49785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49786. },
  49787. "port_directions": {
  49788. "I0": "input",
  49789. "I1": "input",
  49790. "I2": "input",
  49791. "I3": "input",
  49792. "O": "output"
  49793. },
  49794. "connections": {
  49795. "I0": [ "0" ],
  49796. "I1": [ 2142 ],
  49797. "I2": [ 2165 ],
  49798. "I3": [ 2080 ],
  49799. "O": [ 2166 ]
  49800. }
  49801. },
  49802. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_14_SB_DFF_Q": {
  49803. "hide_name": 0,
  49804. "type": "SB_DFF",
  49805. "parameters": {
  49806. },
  49807. "attributes": {
  49808. "module_not_derived": "00000000000000000000000000000001",
  49809. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49810. },
  49811. "port_directions": {
  49812. "C": "input",
  49813. "D": "input",
  49814. "Q": "output"
  49815. },
  49816. "connections": {
  49817. "C": [ 42 ],
  49818. "D": [ 2141 ],
  49819. "Q": [ 2167 ]
  49820. }
  49821. },
  49822. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_15_SB_LUT4_I1": {
  49823. "hide_name": 0,
  49824. "type": "SB_LUT4",
  49825. "parameters": {
  49826. "LUT_INIT": "1111000011001100"
  49827. },
  49828. "attributes": {
  49829. "module_not_derived": "00000000000000000000000000000001",
  49830. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49831. },
  49832. "port_directions": {
  49833. "I0": "input",
  49834. "I1": "input",
  49835. "I2": "input",
  49836. "I3": "input",
  49837. "O": "output"
  49838. },
  49839. "connections": {
  49840. "I0": [ "0" ],
  49841. "I1": [ 2124 ],
  49842. "I2": [ 2168 ],
  49843. "I3": [ 2078 ],
  49844. "O": [ 2169 ]
  49845. }
  49846. },
  49847. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_15_SB_LUT4_I1_O_SB_LUT4_I2": {
  49848. "hide_name": 0,
  49849. "type": "SB_LUT4",
  49850. "parameters": {
  49851. "LUT_INIT": "1100110011110000"
  49852. },
  49853. "attributes": {
  49854. "module_not_derived": "00000000000000000000000000000001",
  49855. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49856. },
  49857. "port_directions": {
  49858. "I0": "input",
  49859. "I1": "input",
  49860. "I2": "input",
  49861. "I3": "input",
  49862. "O": "output"
  49863. },
  49864. "connections": {
  49865. "I0": [ "0" ],
  49866. "I1": [ 2140 ],
  49867. "I2": [ 2169 ],
  49868. "I3": [ 2080 ],
  49869. "O": [ 2170 ]
  49870. }
  49871. },
  49872. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_1_SB_LUT4_I1": {
  49873. "hide_name": 0,
  49874. "type": "SB_LUT4",
  49875. "parameters": {
  49876. "LUT_INIT": "1111000011001100"
  49877. },
  49878. "attributes": {
  49879. "module_not_derived": "00000000000000000000000000000001",
  49880. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49881. },
  49882. "port_directions": {
  49883. "I0": "input",
  49884. "I1": "input",
  49885. "I2": "input",
  49886. "I3": "input",
  49887. "O": "output"
  49888. },
  49889. "connections": {
  49890. "I0": [ "0" ],
  49891. "I1": [ 2138 ],
  49892. "I2": [ 2171 ],
  49893. "I3": [ 2078 ],
  49894. "O": [ 2172 ]
  49895. }
  49896. },
  49897. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_1_SB_LUT4_I1_O_SB_LUT4_I2": {
  49898. "hide_name": 0,
  49899. "type": "SB_LUT4",
  49900. "parameters": {
  49901. "LUT_INIT": "1100110011110000"
  49902. },
  49903. "attributes": {
  49904. "module_not_derived": "00000000000000000000000000000001",
  49905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49906. },
  49907. "port_directions": {
  49908. "I0": "input",
  49909. "I1": "input",
  49910. "I2": "input",
  49911. "I3": "input",
  49912. "O": "output"
  49913. },
  49914. "connections": {
  49915. "I0": [ "0" ],
  49916. "I1": [ 2154 ],
  49917. "I2": [ 2172 ],
  49918. "I3": [ 2080 ],
  49919. "O": [ 2173 ]
  49920. }
  49921. },
  49922. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_2_SB_DFF_Q": {
  49923. "hide_name": 0,
  49924. "type": "SB_DFF",
  49925. "parameters": {
  49926. },
  49927. "attributes": {
  49928. "module_not_derived": "00000000000000000000000000000001",
  49929. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  49930. },
  49931. "port_directions": {
  49932. "C": "input",
  49933. "D": "input",
  49934. "Q": "output"
  49935. },
  49936. "connections": {
  49937. "C": [ 42 ],
  49938. "D": [ 2153 ],
  49939. "Q": [ 2174 ]
  49940. }
  49941. },
  49942. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_3_SB_LUT4_I1": {
  49943. "hide_name": 0,
  49944. "type": "SB_LUT4",
  49945. "parameters": {
  49946. "LUT_INIT": "1111000011001100"
  49947. },
  49948. "attributes": {
  49949. "module_not_derived": "00000000000000000000000000000001",
  49950. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49951. },
  49952. "port_directions": {
  49953. "I0": "input",
  49954. "I1": "input",
  49955. "I2": "input",
  49956. "I3": "input",
  49957. "O": "output"
  49958. },
  49959. "connections": {
  49960. "I0": [ "0" ],
  49961. "I1": [ 2136 ],
  49962. "I2": [ 2175 ],
  49963. "I3": [ 2078 ],
  49964. "O": [ 2176 ]
  49965. }
  49966. },
  49967. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_3_SB_LUT4_I1_O_SB_LUT4_I2": {
  49968. "hide_name": 0,
  49969. "type": "SB_LUT4",
  49970. "parameters": {
  49971. "LUT_INIT": "1100110011110000"
  49972. },
  49973. "attributes": {
  49974. "module_not_derived": "00000000000000000000000000000001",
  49975. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  49976. },
  49977. "port_directions": {
  49978. "I0": "input",
  49979. "I1": "input",
  49980. "I2": "input",
  49981. "I3": "input",
  49982. "O": "output"
  49983. },
  49984. "connections": {
  49985. "I0": [ "0" ],
  49986. "I1": [ 2152 ],
  49987. "I2": [ 2176 ],
  49988. "I3": [ 2080 ],
  49989. "O": [ 2177 ]
  49990. }
  49991. },
  49992. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_4_SB_DFF_Q": {
  49993. "hide_name": 0,
  49994. "type": "SB_DFF",
  49995. "parameters": {
  49996. },
  49997. "attributes": {
  49998. "module_not_derived": "00000000000000000000000000000001",
  49999. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50000. },
  50001. "port_directions": {
  50002. "C": "input",
  50003. "D": "input",
  50004. "Q": "output"
  50005. },
  50006. "connections": {
  50007. "C": [ 42 ],
  50008. "D": [ 2151 ],
  50009. "Q": [ 2178 ]
  50010. }
  50011. },
  50012. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_5_SB_DFF_Q": {
  50013. "hide_name": 0,
  50014. "type": "SB_DFF",
  50015. "parameters": {
  50016. },
  50017. "attributes": {
  50018. "module_not_derived": "00000000000000000000000000000001",
  50019. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50020. },
  50021. "port_directions": {
  50022. "C": "input",
  50023. "D": "input",
  50024. "Q": "output"
  50025. },
  50026. "connections": {
  50027. "C": [ 42 ],
  50028. "D": [ 2150 ],
  50029. "Q": [ 2179 ]
  50030. }
  50031. },
  50032. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_6_SB_DFF_Q": {
  50033. "hide_name": 0,
  50034. "type": "SB_DFF",
  50035. "parameters": {
  50036. },
  50037. "attributes": {
  50038. "module_not_derived": "00000000000000000000000000000001",
  50039. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50040. },
  50041. "port_directions": {
  50042. "C": "input",
  50043. "D": "input",
  50044. "Q": "output"
  50045. },
  50046. "connections": {
  50047. "C": [ 42 ],
  50048. "D": [ 2149 ],
  50049. "Q": [ 2180 ]
  50050. }
  50051. },
  50052. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_7_SB_DFF_Q": {
  50053. "hide_name": 0,
  50054. "type": "SB_DFF",
  50055. "parameters": {
  50056. },
  50057. "attributes": {
  50058. "module_not_derived": "00000000000000000000000000000001",
  50059. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50060. },
  50061. "port_directions": {
  50062. "C": "input",
  50063. "D": "input",
  50064. "Q": "output"
  50065. },
  50066. "connections": {
  50067. "C": [ 42 ],
  50068. "D": [ 2148 ],
  50069. "Q": [ 2181 ]
  50070. }
  50071. },
  50072. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_8_SB_LUT4_I1": {
  50073. "hide_name": 0,
  50074. "type": "SB_LUT4",
  50075. "parameters": {
  50076. "LUT_INIT": "1111000011001100"
  50077. },
  50078. "attributes": {
  50079. "module_not_derived": "00000000000000000000000000000001",
  50080. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50081. },
  50082. "port_directions": {
  50083. "I0": "input",
  50084. "I1": "input",
  50085. "I2": "input",
  50086. "I3": "input",
  50087. "O": "output"
  50088. },
  50089. "connections": {
  50090. "I0": [ "0" ],
  50091. "I1": [ 2131 ],
  50092. "I2": [ 2182 ],
  50093. "I3": [ 2078 ],
  50094. "O": [ 2183 ]
  50095. }
  50096. },
  50097. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_8_SB_LUT4_I1_O_SB_LUT4_I2": {
  50098. "hide_name": 0,
  50099. "type": "SB_LUT4",
  50100. "parameters": {
  50101. "LUT_INIT": "1100110011110000"
  50102. },
  50103. "attributes": {
  50104. "module_not_derived": "00000000000000000000000000000001",
  50105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50106. },
  50107. "port_directions": {
  50108. "I0": "input",
  50109. "I1": "input",
  50110. "I2": "input",
  50111. "I3": "input",
  50112. "O": "output"
  50113. },
  50114. "connections": {
  50115. "I0": [ "0" ],
  50116. "I1": [ 2147 ],
  50117. "I2": [ 2183 ],
  50118. "I3": [ 2080 ],
  50119. "O": [ 2184 ]
  50120. }
  50121. },
  50122. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_9_SB_LUT4_I1": {
  50123. "hide_name": 0,
  50124. "type": "SB_LUT4",
  50125. "parameters": {
  50126. "LUT_INIT": "1111000011001100"
  50127. },
  50128. "attributes": {
  50129. "module_not_derived": "00000000000000000000000000000001",
  50130. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50131. },
  50132. "port_directions": {
  50133. "I0": "input",
  50134. "I1": "input",
  50135. "I2": "input",
  50136. "I3": "input",
  50137. "O": "output"
  50138. },
  50139. "connections": {
  50140. "I0": [ "0" ],
  50141. "I1": [ 2130 ],
  50142. "I2": [ 2185 ],
  50143. "I3": [ 2078 ],
  50144. "O": [ 2186 ]
  50145. }
  50146. },
  50147. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_9_SB_LUT4_I1_O_SB_LUT4_I2": {
  50148. "hide_name": 0,
  50149. "type": "SB_LUT4",
  50150. "parameters": {
  50151. "LUT_INIT": "1100110011110000"
  50152. },
  50153. "attributes": {
  50154. "module_not_derived": "00000000000000000000000000000001",
  50155. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50156. },
  50157. "port_directions": {
  50158. "I0": "input",
  50159. "I1": "input",
  50160. "I2": "input",
  50161. "I3": "input",
  50162. "O": "output"
  50163. },
  50164. "connections": {
  50165. "I0": [ "0" ],
  50166. "I1": [ 2146 ],
  50167. "I2": [ 2186 ],
  50168. "I3": [ 2080 ],
  50169. "O": [ 2187 ]
  50170. }
  50171. },
  50172. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_SB_LUT4_I1": {
  50173. "hide_name": 0,
  50174. "type": "SB_LUT4",
  50175. "parameters": {
  50176. "LUT_INIT": "1111000011001100"
  50177. },
  50178. "attributes": {
  50179. "module_not_derived": "00000000000000000000000000000001",
  50180. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50181. },
  50182. "port_directions": {
  50183. "I0": "input",
  50184. "I1": "input",
  50185. "I2": "input",
  50186. "I3": "input",
  50187. "O": "output"
  50188. },
  50189. "connections": {
  50190. "I0": [ "0" ],
  50191. "I1": [ 2139 ],
  50192. "I2": [ 2188 ],
  50193. "I3": [ 2078 ],
  50194. "O": [ 2189 ]
  50195. }
  50196. },
  50197. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_SB_LUT4_I1_O_SB_LUT4_I2": {
  50198. "hide_name": 0,
  50199. "type": "SB_LUT4",
  50200. "parameters": {
  50201. "LUT_INIT": "1100110011110000"
  50202. },
  50203. "attributes": {
  50204. "module_not_derived": "00000000000000000000000000000001",
  50205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50206. },
  50207. "port_directions": {
  50208. "I0": "input",
  50209. "I1": "input",
  50210. "I2": "input",
  50211. "I3": "input",
  50212. "O": "output"
  50213. },
  50214. "connections": {
  50215. "I0": [ "0" ],
  50216. "I1": [ 2155 ],
  50217. "I2": [ 2189 ],
  50218. "I3": [ 2080 ],
  50219. "O": [ 2190 ]
  50220. }
  50221. },
  50222. "cpu_I.RegFilePlugin_regFile.1.0": {
  50223. "hide_name": 0,
  50224. "type": "SB_RAM40_4K",
  50225. "parameters": {
  50226. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50227. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50228. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50229. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50230. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50231. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50232. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50233. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50234. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50235. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50236. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50237. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50238. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50239. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50240. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50241. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50242. "READ_MODE": "00",
  50243. "WRITE_MODE": "00"
  50244. },
  50245. "attributes": {
  50246. "module_not_derived": "00000000000000000000000000000001",
  50247. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  50248. },
  50249. "port_directions": {
  50250. "MASK": "input",
  50251. "RADDR": "input",
  50252. "RCLK": "input",
  50253. "RCLKE": "input",
  50254. "RDATA": "output",
  50255. "RE": "input",
  50256. "WADDR": "input",
  50257. "WCLK": "input",
  50258. "WCLKE": "input",
  50259. "WDATA": "input",
  50260. "WE": "input"
  50261. },
  50262. "connections": {
  50263. "MASK": [ 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029 ],
  50264. "RADDR": [ 2191, 2192, 2193, 2194, 2195, 2035, "0", "0", "0", "0", "0" ],
  50265. "RCLK": [ 42 ],
  50266. "RCLKE": [ "1" ],
  50267. "RDATA": [ 2088, 2196, 2197, 2198, 2199, 2200, 2201, 2202, 2203, 2204, 2205, 2206, 2207, 2208, 2209, 2210 ],
  50268. "RE": [ "1" ],
  50269. "WADDR": [ 2052, 2053, 2054, 2055, 2056, 2057, "0", "0", "0", "0", "0" ],
  50270. "WCLK": [ 42 ],
  50271. "WCLKE": [ 2058 ],
  50272. "WDATA": [ 2059, 2060, 2061, 2062, 2063, 2064, 2065, 2066, 2067, 2068, 2069, 2070, 2071, 2072, 2073, 2074 ],
  50273. "WE": [ "1" ]
  50274. }
  50275. },
  50276. "cpu_I.RegFilePlugin_regFile.1.0_RADDR_1_SB_LUT4_O": {
  50277. "hide_name": 0,
  50278. "type": "SB_LUT4",
  50279. "parameters": {
  50280. "LUT_INIT": "1111000011001100"
  50281. },
  50282. "attributes": {
  50283. "module_not_derived": "00000000000000000000000000000001",
  50284. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50285. },
  50286. "port_directions": {
  50287. "I0": "input",
  50288. "I1": "input",
  50289. "I2": "input",
  50290. "I3": "input",
  50291. "O": "output"
  50292. },
  50293. "connections": {
  50294. "I0": [ "0" ],
  50295. "I1": [ 1533 ],
  50296. "I2": [ 1322 ],
  50297. "I3": [ 1475 ],
  50298. "O": [ 2193 ]
  50299. }
  50300. },
  50301. "cpu_I.RegFilePlugin_regFile.1.0_RADDR_1_SB_LUT4_O_1": {
  50302. "hide_name": 0,
  50303. "type": "SB_LUT4",
  50304. "parameters": {
  50305. "LUT_INIT": "1111000011001100"
  50306. },
  50307. "attributes": {
  50308. "module_not_derived": "00000000000000000000000000000001",
  50309. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50310. },
  50311. "port_directions": {
  50312. "I0": "input",
  50313. "I1": "input",
  50314. "I2": "input",
  50315. "I3": "input",
  50316. "O": "output"
  50317. },
  50318. "connections": {
  50319. "I0": [ "0" ],
  50320. "I1": [ 1534 ],
  50321. "I2": [ 1325 ],
  50322. "I3": [ 1475 ],
  50323. "O": [ 2192 ]
  50324. }
  50325. },
  50326. "cpu_I.RegFilePlugin_regFile.1.0_RADDR_SB_LUT4_O": {
  50327. "hide_name": 0,
  50328. "type": "SB_LUT4",
  50329. "parameters": {
  50330. "LUT_INIT": "1111000011001100"
  50331. },
  50332. "attributes": {
  50333. "module_not_derived": "00000000000000000000000000000001",
  50334. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50335. },
  50336. "port_directions": {
  50337. "I0": "input",
  50338. "I1": "input",
  50339. "I2": "input",
  50340. "I3": "input",
  50341. "O": "output"
  50342. },
  50343. "connections": {
  50344. "I0": [ "0" ],
  50345. "I1": [ 1531 ],
  50346. "I2": [ 1316 ],
  50347. "I3": [ 1475 ],
  50348. "O": [ 2195 ]
  50349. }
  50350. },
  50351. "cpu_I.RegFilePlugin_regFile.1.0_RADDR_SB_LUT4_O_1": {
  50352. "hide_name": 0,
  50353. "type": "SB_LUT4",
  50354. "parameters": {
  50355. "LUT_INIT": "1111000011001100"
  50356. },
  50357. "attributes": {
  50358. "module_not_derived": "00000000000000000000000000000001",
  50359. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50360. },
  50361. "port_directions": {
  50362. "I0": "input",
  50363. "I1": "input",
  50364. "I2": "input",
  50365. "I3": "input",
  50366. "O": "output"
  50367. },
  50368. "connections": {
  50369. "I0": [ "0" ],
  50370. "I1": [ 1532 ],
  50371. "I2": [ 1319 ],
  50372. "I3": [ 1475 ],
  50373. "O": [ 2194 ]
  50374. }
  50375. },
  50376. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_10_SB_LUT4_I1": {
  50377. "hide_name": 0,
  50378. "type": "SB_LUT4",
  50379. "parameters": {
  50380. "LUT_INIT": "1111000011001100"
  50381. },
  50382. "attributes": {
  50383. "module_not_derived": "00000000000000000000000000000001",
  50384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50385. },
  50386. "port_directions": {
  50387. "I0": "input",
  50388. "I1": "input",
  50389. "I2": "input",
  50390. "I3": "input",
  50391. "O": "output"
  50392. },
  50393. "connections": {
  50394. "I0": [ "0" ],
  50395. "I1": [ 2200 ],
  50396. "I2": [ 2076 ],
  50397. "I3": [ 2089 ],
  50398. "O": [ 2211 ]
  50399. }
  50400. },
  50401. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_10_SB_LUT4_I1_O_SB_LUT4_I2": {
  50402. "hide_name": 0,
  50403. "type": "SB_LUT4",
  50404. "parameters": {
  50405. "LUT_INIT": "1100110011110000"
  50406. },
  50407. "attributes": {
  50408. "module_not_derived": "00000000000000000000000000000001",
  50409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50410. },
  50411. "port_directions": {
  50412. "I0": "input",
  50413. "I1": "input",
  50414. "I2": "input",
  50415. "I3": "input",
  50416. "O": "output"
  50417. },
  50418. "connections": {
  50419. "I0": [ "0" ],
  50420. "I1": [ 2064 ],
  50421. "I2": [ 2211 ],
  50422. "I3": [ 2094 ],
  50423. "O": [ 2212 ]
  50424. }
  50425. },
  50426. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_11_SB_DFF_Q": {
  50427. "hide_name": 0,
  50428. "type": "SB_DFF",
  50429. "parameters": {
  50430. },
  50431. "attributes": {
  50432. "module_not_derived": "00000000000000000000000000000001",
  50433. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50434. },
  50435. "port_directions": {
  50436. "C": "input",
  50437. "D": "input",
  50438. "Q": "output"
  50439. },
  50440. "connections": {
  50441. "C": [ 42 ],
  50442. "D": [ 2063 ],
  50443. "Q": [ 2077 ]
  50444. }
  50445. },
  50446. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_12_SB_LUT4_I1": {
  50447. "hide_name": 0,
  50448. "type": "SB_LUT4",
  50449. "parameters": {
  50450. "LUT_INIT": "1111000011001100"
  50451. },
  50452. "attributes": {
  50453. "module_not_derived": "00000000000000000000000000000001",
  50454. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50455. },
  50456. "port_directions": {
  50457. "I0": "input",
  50458. "I1": "input",
  50459. "I2": "input",
  50460. "I3": "input",
  50461. "O": "output"
  50462. },
  50463. "connections": {
  50464. "I0": [ "0" ],
  50465. "I1": [ 2198 ],
  50466. "I2": [ 2082 ],
  50467. "I3": [ 2089 ],
  50468. "O": [ 2213 ]
  50469. }
  50470. },
  50471. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_12_SB_LUT4_I1_O_SB_LUT4_I2": {
  50472. "hide_name": 0,
  50473. "type": "SB_LUT4",
  50474. "parameters": {
  50475. "LUT_INIT": "1100110011110000"
  50476. },
  50477. "attributes": {
  50478. "module_not_derived": "00000000000000000000000000000001",
  50479. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50480. },
  50481. "port_directions": {
  50482. "I0": "input",
  50483. "I1": "input",
  50484. "I2": "input",
  50485. "I3": "input",
  50486. "O": "output"
  50487. },
  50488. "connections": {
  50489. "I0": [ "0" ],
  50490. "I1": [ 2062 ],
  50491. "I2": [ 2213 ],
  50492. "I3": [ 2094 ],
  50493. "O": [ 2214 ]
  50494. }
  50495. },
  50496. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_13_SB_DFF_Q": {
  50497. "hide_name": 0,
  50498. "type": "SB_DFF",
  50499. "parameters": {
  50500. },
  50501. "attributes": {
  50502. "module_not_derived": "00000000000000000000000000000001",
  50503. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50504. },
  50505. "port_directions": {
  50506. "C": "input",
  50507. "D": "input",
  50508. "Q": "output"
  50509. },
  50510. "connections": {
  50511. "C": [ 42 ],
  50512. "D": [ 2061 ],
  50513. "Q": [ 2083 ]
  50514. }
  50515. },
  50516. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_14_SB_LUT4_I1": {
  50517. "hide_name": 0,
  50518. "type": "SB_LUT4",
  50519. "parameters": {
  50520. "LUT_INIT": "1111000011001100"
  50521. },
  50522. "attributes": {
  50523. "module_not_derived": "00000000000000000000000000000001",
  50524. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50525. },
  50526. "port_directions": {
  50527. "I0": "input",
  50528. "I1": "input",
  50529. "I2": "input",
  50530. "I3": "input",
  50531. "O": "output"
  50532. },
  50533. "connections": {
  50534. "I0": [ "0" ],
  50535. "I1": [ 2196 ],
  50536. "I2": [ 2086 ],
  50537. "I3": [ 2089 ],
  50538. "O": [ 2215 ]
  50539. }
  50540. },
  50541. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_14_SB_LUT4_I1_O_SB_LUT4_I2": {
  50542. "hide_name": 0,
  50543. "type": "SB_LUT4",
  50544. "parameters": {
  50545. "LUT_INIT": "1100110011110000"
  50546. },
  50547. "attributes": {
  50548. "module_not_derived": "00000000000000000000000000000001",
  50549. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50550. },
  50551. "port_directions": {
  50552. "I0": "input",
  50553. "I1": "input",
  50554. "I2": "input",
  50555. "I3": "input",
  50556. "O": "output"
  50557. },
  50558. "connections": {
  50559. "I0": [ "0" ],
  50560. "I1": [ 2060 ],
  50561. "I2": [ 2215 ],
  50562. "I3": [ 2094 ],
  50563. "O": [ 2216 ]
  50564. }
  50565. },
  50566. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q": {
  50567. "hide_name": 0,
  50568. "type": "SB_DFF",
  50569. "parameters": {
  50570. },
  50571. "attributes": {
  50572. "module_not_derived": "00000000000000000000000000000001",
  50573. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50574. },
  50575. "port_directions": {
  50576. "C": "input",
  50577. "D": "input",
  50578. "Q": "output"
  50579. },
  50580. "connections": {
  50581. "C": [ 42 ],
  50582. "D": [ 2217 ],
  50583. "Q": [ 2089 ]
  50584. }
  50585. },
  50586. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q_D_SB_LUT4_O": {
  50587. "hide_name": 0,
  50588. "type": "SB_LUT4",
  50589. "parameters": {
  50590. "LUT_INIT": "1100000000000000"
  50591. },
  50592. "attributes": {
  50593. "module_not_derived": "00000000000000000000000000000001",
  50594. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50595. },
  50596. "port_directions": {
  50597. "I0": "input",
  50598. "I1": "input",
  50599. "I2": "input",
  50600. "I3": "input",
  50601. "O": "output"
  50602. },
  50603. "connections": {
  50604. "I0": [ "0" ],
  50605. "I1": [ 2218 ],
  50606. "I2": [ 2219 ],
  50607. "I3": [ 2220 ],
  50608. "O": [ 2217 ]
  50609. }
  50610. },
  50611. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q_D_SB_LUT4_O_I1_SB_LUT4_O": {
  50612. "hide_name": 0,
  50613. "type": "SB_LUT4",
  50614. "parameters": {
  50615. "LUT_INIT": "0000000010000100"
  50616. },
  50617. "attributes": {
  50618. "module_not_derived": "00000000000000000000000000000001",
  50619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  50620. },
  50621. "port_directions": {
  50622. "I0": "input",
  50623. "I1": "input",
  50624. "I2": "input",
  50625. "I3": "input",
  50626. "O": "output"
  50627. },
  50628. "connections": {
  50629. "I0": [ 2052 ],
  50630. "I1": [ 2161 ],
  50631. "I2": [ 2191 ],
  50632. "I3": [ 2221 ],
  50633. "O": [ 2220 ]
  50634. }
  50635. },
  50636. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q_D_SB_LUT4_O_I1_SB_LUT4_O_1": {
  50637. "hide_name": 0,
  50638. "type": "SB_LUT4",
  50639. "parameters": {
  50640. "LUT_INIT": "1000001001000001"
  50641. },
  50642. "attributes": {
  50643. "module_not_derived": "00000000000000000000000000000001",
  50644. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  50645. },
  50646. "port_directions": {
  50647. "I0": "input",
  50648. "I1": "input",
  50649. "I2": "input",
  50650. "I3": "input",
  50651. "O": "output"
  50652. },
  50653. "connections": {
  50654. "I0": [ 2056 ],
  50655. "I1": [ 2055 ],
  50656. "I2": [ 2194 ],
  50657. "I3": [ 2195 ],
  50658. "O": [ 2218 ]
  50659. }
  50660. },
  50661. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q_D_SB_LUT4_O_I1_SB_LUT4_O_2": {
  50662. "hide_name": 0,
  50663. "type": "SB_LUT4",
  50664. "parameters": {
  50665. "LUT_INIT": "1010001001010001"
  50666. },
  50667. "attributes": {
  50668. "module_not_derived": "00000000000000000000000000000001",
  50669. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  50670. },
  50671. "port_directions": {
  50672. "I0": "input",
  50673. "I1": "input",
  50674. "I2": "input",
  50675. "I3": "input",
  50676. "O": "output"
  50677. },
  50678. "connections": {
  50679. "I0": [ 2054 ],
  50680. "I1": [ 2053 ],
  50681. "I2": [ 2192 ],
  50682. "I3": [ 2193 ],
  50683. "O": [ 2219 ]
  50684. }
  50685. },
  50686. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_1_SB_DFF_Q": {
  50687. "hide_name": 0,
  50688. "type": "SB_DFF",
  50689. "parameters": {
  50690. },
  50691. "attributes": {
  50692. "module_not_derived": "00000000000000000000000000000001",
  50693. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50694. },
  50695. "port_directions": {
  50696. "C": "input",
  50697. "D": "input",
  50698. "Q": "output"
  50699. },
  50700. "connections": {
  50701. "C": [ 42 ],
  50702. "D": [ 2073 ],
  50703. "Q": [ 2095 ]
  50704. }
  50705. },
  50706. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_2_SB_DFF_Q": {
  50707. "hide_name": 0,
  50708. "type": "SB_DFF",
  50709. "parameters": {
  50710. },
  50711. "attributes": {
  50712. "module_not_derived": "00000000000000000000000000000001",
  50713. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50714. },
  50715. "port_directions": {
  50716. "C": "input",
  50717. "D": "input",
  50718. "Q": "output"
  50719. },
  50720. "connections": {
  50721. "C": [ 42 ],
  50722. "D": [ 2072 ],
  50723. "Q": [ 2098 ]
  50724. }
  50725. },
  50726. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_3_SB_DFF_Q": {
  50727. "hide_name": 0,
  50728. "type": "SB_DFF",
  50729. "parameters": {
  50730. },
  50731. "attributes": {
  50732. "module_not_derived": "00000000000000000000000000000001",
  50733. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50734. },
  50735. "port_directions": {
  50736. "C": "input",
  50737. "D": "input",
  50738. "Q": "output"
  50739. },
  50740. "connections": {
  50741. "C": [ 42 ],
  50742. "D": [ 2071 ],
  50743. "Q": [ 2101 ]
  50744. }
  50745. },
  50746. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_4_SB_DFF_Q": {
  50747. "hide_name": 0,
  50748. "type": "SB_DFF",
  50749. "parameters": {
  50750. },
  50751. "attributes": {
  50752. "module_not_derived": "00000000000000000000000000000001",
  50753. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50754. },
  50755. "port_directions": {
  50756. "C": "input",
  50757. "D": "input",
  50758. "Q": "output"
  50759. },
  50760. "connections": {
  50761. "C": [ 42 ],
  50762. "D": [ 2070 ],
  50763. "Q": [ 2104 ]
  50764. }
  50765. },
  50766. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_5_SB_DFF_Q": {
  50767. "hide_name": 0,
  50768. "type": "SB_DFF",
  50769. "parameters": {
  50770. },
  50771. "attributes": {
  50772. "module_not_derived": "00000000000000000000000000000001",
  50773. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50774. },
  50775. "port_directions": {
  50776. "C": "input",
  50777. "D": "input",
  50778. "Q": "output"
  50779. },
  50780. "connections": {
  50781. "C": [ 42 ],
  50782. "D": [ 2069 ],
  50783. "Q": [ 2107 ]
  50784. }
  50785. },
  50786. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_6_SB_DFF_Q": {
  50787. "hide_name": 0,
  50788. "type": "SB_DFF",
  50789. "parameters": {
  50790. },
  50791. "attributes": {
  50792. "module_not_derived": "00000000000000000000000000000001",
  50793. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50794. },
  50795. "port_directions": {
  50796. "C": "input",
  50797. "D": "input",
  50798. "Q": "output"
  50799. },
  50800. "connections": {
  50801. "C": [ 42 ],
  50802. "D": [ 2068 ],
  50803. "Q": [ 2110 ]
  50804. }
  50805. },
  50806. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_7_SB_DFF_Q": {
  50807. "hide_name": 0,
  50808. "type": "SB_DFF",
  50809. "parameters": {
  50810. },
  50811. "attributes": {
  50812. "module_not_derived": "00000000000000000000000000000001",
  50813. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50814. },
  50815. "port_directions": {
  50816. "C": "input",
  50817. "D": "input",
  50818. "Q": "output"
  50819. },
  50820. "connections": {
  50821. "C": [ 42 ],
  50822. "D": [ 2067 ],
  50823. "Q": [ 2114 ]
  50824. }
  50825. },
  50826. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_8_SB_DFF_Q": {
  50827. "hide_name": 0,
  50828. "type": "SB_DFF",
  50829. "parameters": {
  50830. },
  50831. "attributes": {
  50832. "module_not_derived": "00000000000000000000000000000001",
  50833. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50834. },
  50835. "port_directions": {
  50836. "C": "input",
  50837. "D": "input",
  50838. "Q": "output"
  50839. },
  50840. "connections": {
  50841. "C": [ 42 ],
  50842. "D": [ 2066 ],
  50843. "Q": [ 2117 ]
  50844. }
  50845. },
  50846. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_9_SB_DFF_Q": {
  50847. "hide_name": 0,
  50848. "type": "SB_DFF",
  50849. "parameters": {
  50850. },
  50851. "attributes": {
  50852. "module_not_derived": "00000000000000000000000000000001",
  50853. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  50854. },
  50855. "port_directions": {
  50856. "C": "input",
  50857. "D": "input",
  50858. "Q": "output"
  50859. },
  50860. "connections": {
  50861. "C": [ 42 ],
  50862. "D": [ 2065 ],
  50863. "Q": [ 2120 ]
  50864. }
  50865. },
  50866. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_SB_LUT4_I1": {
  50867. "hide_name": 0,
  50868. "type": "SB_LUT4",
  50869. "parameters": {
  50870. "LUT_INIT": "1111000011001100"
  50871. },
  50872. "attributes": {
  50873. "module_not_derived": "00000000000000000000000000000001",
  50874. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50875. },
  50876. "port_directions": {
  50877. "I0": "input",
  50878. "I1": "input",
  50879. "I2": "input",
  50880. "I3": "input",
  50881. "O": "output"
  50882. },
  50883. "connections": {
  50884. "I0": [ "0" ],
  50885. "I1": [ 2210 ],
  50886. "I2": [ 2123 ],
  50887. "I3": [ 2089 ],
  50888. "O": [ 2222 ]
  50889. }
  50890. },
  50891. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2": {
  50892. "hide_name": 0,
  50893. "type": "SB_LUT4",
  50894. "parameters": {
  50895. "LUT_INIT": "1100110011110000"
  50896. },
  50897. "attributes": {
  50898. "module_not_derived": "00000000000000000000000000000001",
  50899. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50900. },
  50901. "port_directions": {
  50902. "I0": "input",
  50903. "I1": "input",
  50904. "I2": "input",
  50905. "I3": "input",
  50906. "O": "output"
  50907. },
  50908. "connections": {
  50909. "I0": [ "0" ],
  50910. "I1": [ 2074 ],
  50911. "I2": [ 2222 ],
  50912. "I3": [ 2094 ],
  50913. "O": [ 2223 ]
  50914. }
  50915. },
  50916. "cpu_I.RegFilePlugin_regFile.1.1": {
  50917. "hide_name": 0,
  50918. "type": "SB_RAM40_4K",
  50919. "parameters": {
  50920. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50921. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50922. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50923. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50924. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50925. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50926. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50927. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50928. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50929. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50930. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50931. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50932. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50933. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50934. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50935. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  50936. "READ_MODE": "00",
  50937. "WRITE_MODE": "00"
  50938. },
  50939. "attributes": {
  50940. "module_not_derived": "00000000000000000000000000000001",
  50941. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  50942. },
  50943. "port_directions": {
  50944. "MASK": "input",
  50945. "RADDR": "input",
  50946. "RCLK": "input",
  50947. "RCLKE": "input",
  50948. "RDATA": "output",
  50949. "RE": "input",
  50950. "WADDR": "input",
  50951. "WCLK": "input",
  50952. "WCLKE": "input",
  50953. "WDATA": "input",
  50954. "WE": "input"
  50955. },
  50956. "connections": {
  50957. "MASK": [ 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029 ],
  50958. "RADDR": [ 2191, 2192, 2193, 2194, 2195, 2035, "0", "0", "0", "0", "0" ],
  50959. "RCLK": [ 42 ],
  50960. "RCLKE": [ "1" ],
  50961. "RDATA": [ 2224, 2225, 2226, 2227, 2228, 2229, 2230, 2231, 2232, 2233, 2234, 2235, 2236, 2237, 2238, 2239 ],
  50962. "RE": [ "1" ],
  50963. "WADDR": [ 2052, 2053, 2054, 2055, 2056, 2057, "0", "0", "0", "0", "0" ],
  50964. "WCLK": [ 42 ],
  50965. "WCLKE": [ 2058 ],
  50966. "WDATA": [ 2140, 2141, 2142, 2143, 2144, 2145, 2146, 2147, 2148, 2149, 2150, 2151, 2152, 2153, 2154, 2155 ],
  50967. "WE": [ "1" ]
  50968. }
  50969. },
  50970. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_10_SB_LUT4_I1": {
  50971. "hide_name": 0,
  50972. "type": "SB_LUT4",
  50973. "parameters": {
  50974. "LUT_INIT": "1111000011001100"
  50975. },
  50976. "attributes": {
  50977. "module_not_derived": "00000000000000000000000000000001",
  50978. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  50979. },
  50980. "port_directions": {
  50981. "I0": "input",
  50982. "I1": "input",
  50983. "I2": "input",
  50984. "I3": "input",
  50985. "O": "output"
  50986. },
  50987. "connections": {
  50988. "I0": [ "0" ],
  50989. "I1": [ 2229 ],
  50990. "I2": [ 2157 ],
  50991. "I3": [ 2089 ],
  50992. "O": [ 2240 ]
  50993. }
  50994. },
  50995. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_10_SB_LUT4_I1_O_SB_LUT4_I2": {
  50996. "hide_name": 0,
  50997. "type": "SB_LUT4",
  50998. "parameters": {
  50999. "LUT_INIT": "1100110011110000"
  51000. },
  51001. "attributes": {
  51002. "module_not_derived": "00000000000000000000000000000001",
  51003. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51004. },
  51005. "port_directions": {
  51006. "I0": "input",
  51007. "I1": "input",
  51008. "I2": "input",
  51009. "I3": "input",
  51010. "O": "output"
  51011. },
  51012. "connections": {
  51013. "I0": [ "0" ],
  51014. "I1": [ 2145 ],
  51015. "I2": [ 2240 ],
  51016. "I3": [ 2094 ],
  51017. "O": [ 2241 ]
  51018. }
  51019. },
  51020. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_11_SB_LUT4_I1": {
  51021. "hide_name": 0,
  51022. "type": "SB_LUT4",
  51023. "parameters": {
  51024. "LUT_INIT": "1111000011001100"
  51025. },
  51026. "attributes": {
  51027. "module_not_derived": "00000000000000000000000000000001",
  51028. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51029. },
  51030. "port_directions": {
  51031. "I0": "input",
  51032. "I1": "input",
  51033. "I2": "input",
  51034. "I3": "input",
  51035. "O": "output"
  51036. },
  51037. "connections": {
  51038. "I0": [ "0" ],
  51039. "I1": [ 2228 ],
  51040. "I2": [ 2162 ],
  51041. "I3": [ 2089 ],
  51042. "O": [ 2242 ]
  51043. }
  51044. },
  51045. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_11_SB_LUT4_I1_O_SB_LUT4_I2": {
  51046. "hide_name": 0,
  51047. "type": "SB_LUT4",
  51048. "parameters": {
  51049. "LUT_INIT": "1100110011110000"
  51050. },
  51051. "attributes": {
  51052. "module_not_derived": "00000000000000000000000000000001",
  51053. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51054. },
  51055. "port_directions": {
  51056. "I0": "input",
  51057. "I1": "input",
  51058. "I2": "input",
  51059. "I3": "input",
  51060. "O": "output"
  51061. },
  51062. "connections": {
  51063. "I0": [ "0" ],
  51064. "I1": [ 2144 ],
  51065. "I2": [ 2242 ],
  51066. "I3": [ 2094 ],
  51067. "O": [ 2243 ]
  51068. }
  51069. },
  51070. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_12_SB_LUT4_I1": {
  51071. "hide_name": 0,
  51072. "type": "SB_LUT4",
  51073. "parameters": {
  51074. "LUT_INIT": "1111000011001100"
  51075. },
  51076. "attributes": {
  51077. "module_not_derived": "00000000000000000000000000000001",
  51078. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51079. },
  51080. "port_directions": {
  51081. "I0": "input",
  51082. "I1": "input",
  51083. "I2": "input",
  51084. "I3": "input",
  51085. "O": "output"
  51086. },
  51087. "connections": {
  51088. "I0": [ "0" ],
  51089. "I1": [ 2227 ],
  51090. "I2": [ 2163 ],
  51091. "I3": [ 2089 ],
  51092. "O": [ 2244 ]
  51093. }
  51094. },
  51095. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_12_SB_LUT4_I1_O_SB_LUT4_I2": {
  51096. "hide_name": 0,
  51097. "type": "SB_LUT4",
  51098. "parameters": {
  51099. "LUT_INIT": "1100110011110000"
  51100. },
  51101. "attributes": {
  51102. "module_not_derived": "00000000000000000000000000000001",
  51103. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51104. },
  51105. "port_directions": {
  51106. "I0": "input",
  51107. "I1": "input",
  51108. "I2": "input",
  51109. "I3": "input",
  51110. "O": "output"
  51111. },
  51112. "connections": {
  51113. "I0": [ "0" ],
  51114. "I1": [ 2143 ],
  51115. "I2": [ 2244 ],
  51116. "I3": [ 2094 ],
  51117. "O": [ 2245 ]
  51118. }
  51119. },
  51120. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_13_SB_DFF_Q": {
  51121. "hide_name": 0,
  51122. "type": "SB_DFF",
  51123. "parameters": {
  51124. },
  51125. "attributes": {
  51126. "module_not_derived": "00000000000000000000000000000001",
  51127. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51128. },
  51129. "port_directions": {
  51130. "C": "input",
  51131. "D": "input",
  51132. "Q": "output"
  51133. },
  51134. "connections": {
  51135. "C": [ 42 ],
  51136. "D": [ 2142 ],
  51137. "Q": [ 2164 ]
  51138. }
  51139. },
  51140. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_14_SB_LUT4_I1": {
  51141. "hide_name": 0,
  51142. "type": "SB_LUT4",
  51143. "parameters": {
  51144. "LUT_INIT": "1111000011001100"
  51145. },
  51146. "attributes": {
  51147. "module_not_derived": "00000000000000000000000000000001",
  51148. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51149. },
  51150. "port_directions": {
  51151. "I0": "input",
  51152. "I1": "input",
  51153. "I2": "input",
  51154. "I3": "input",
  51155. "O": "output"
  51156. },
  51157. "connections": {
  51158. "I0": [ "0" ],
  51159. "I1": [ 2225 ],
  51160. "I2": [ 2167 ],
  51161. "I3": [ 2089 ],
  51162. "O": [ 2246 ]
  51163. }
  51164. },
  51165. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_14_SB_LUT4_I1_O_SB_LUT4_I2": {
  51166. "hide_name": 0,
  51167. "type": "SB_LUT4",
  51168. "parameters": {
  51169. "LUT_INIT": "1100110011110000"
  51170. },
  51171. "attributes": {
  51172. "module_not_derived": "00000000000000000000000000000001",
  51173. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51174. },
  51175. "port_directions": {
  51176. "I0": "input",
  51177. "I1": "input",
  51178. "I2": "input",
  51179. "I3": "input",
  51180. "O": "output"
  51181. },
  51182. "connections": {
  51183. "I0": [ "0" ],
  51184. "I1": [ 2141 ],
  51185. "I2": [ 2246 ],
  51186. "I3": [ 2094 ],
  51187. "O": [ 2247 ]
  51188. }
  51189. },
  51190. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_15_SB_DFF_Q": {
  51191. "hide_name": 0,
  51192. "type": "SB_DFF",
  51193. "parameters": {
  51194. },
  51195. "attributes": {
  51196. "module_not_derived": "00000000000000000000000000000001",
  51197. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51198. },
  51199. "port_directions": {
  51200. "C": "input",
  51201. "D": "input",
  51202. "Q": "output"
  51203. },
  51204. "connections": {
  51205. "C": [ 42 ],
  51206. "D": [ 2140 ],
  51207. "Q": [ 2168 ]
  51208. }
  51209. },
  51210. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_1_SB_DFF_Q": {
  51211. "hide_name": 0,
  51212. "type": "SB_DFF",
  51213. "parameters": {
  51214. },
  51215. "attributes": {
  51216. "module_not_derived": "00000000000000000000000000000001",
  51217. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51218. },
  51219. "port_directions": {
  51220. "C": "input",
  51221. "D": "input",
  51222. "Q": "output"
  51223. },
  51224. "connections": {
  51225. "C": [ 42 ],
  51226. "D": [ 2154 ],
  51227. "Q": [ 2171 ]
  51228. }
  51229. },
  51230. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_2_SB_LUT4_I1": {
  51231. "hide_name": 0,
  51232. "type": "SB_LUT4",
  51233. "parameters": {
  51234. "LUT_INIT": "1111000011001100"
  51235. },
  51236. "attributes": {
  51237. "module_not_derived": "00000000000000000000000000000001",
  51238. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51239. },
  51240. "port_directions": {
  51241. "I0": "input",
  51242. "I1": "input",
  51243. "I2": "input",
  51244. "I3": "input",
  51245. "O": "output"
  51246. },
  51247. "connections": {
  51248. "I0": [ "0" ],
  51249. "I1": [ 2237 ],
  51250. "I2": [ 2174 ],
  51251. "I3": [ 2089 ],
  51252. "O": [ 2248 ]
  51253. }
  51254. },
  51255. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_2_SB_LUT4_I1_O_SB_LUT4_I2": {
  51256. "hide_name": 0,
  51257. "type": "SB_LUT4",
  51258. "parameters": {
  51259. "LUT_INIT": "1100110011110000"
  51260. },
  51261. "attributes": {
  51262. "module_not_derived": "00000000000000000000000000000001",
  51263. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51264. },
  51265. "port_directions": {
  51266. "I0": "input",
  51267. "I1": "input",
  51268. "I2": "input",
  51269. "I3": "input",
  51270. "O": "output"
  51271. },
  51272. "connections": {
  51273. "I0": [ "0" ],
  51274. "I1": [ 2153 ],
  51275. "I2": [ 2248 ],
  51276. "I3": [ 2094 ],
  51277. "O": [ 2249 ]
  51278. }
  51279. },
  51280. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_3_SB_DFF_Q": {
  51281. "hide_name": 0,
  51282. "type": "SB_DFF",
  51283. "parameters": {
  51284. },
  51285. "attributes": {
  51286. "module_not_derived": "00000000000000000000000000000001",
  51287. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51288. },
  51289. "port_directions": {
  51290. "C": "input",
  51291. "D": "input",
  51292. "Q": "output"
  51293. },
  51294. "connections": {
  51295. "C": [ 42 ],
  51296. "D": [ 2152 ],
  51297. "Q": [ 2175 ]
  51298. }
  51299. },
  51300. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_4_SB_LUT4_I1": {
  51301. "hide_name": 0,
  51302. "type": "SB_LUT4",
  51303. "parameters": {
  51304. "LUT_INIT": "1111000011001100"
  51305. },
  51306. "attributes": {
  51307. "module_not_derived": "00000000000000000000000000000001",
  51308. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51309. },
  51310. "port_directions": {
  51311. "I0": "input",
  51312. "I1": "input",
  51313. "I2": "input",
  51314. "I3": "input",
  51315. "O": "output"
  51316. },
  51317. "connections": {
  51318. "I0": [ "0" ],
  51319. "I1": [ 2235 ],
  51320. "I2": [ 2178 ],
  51321. "I3": [ 2089 ],
  51322. "O": [ 2250 ]
  51323. }
  51324. },
  51325. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I2": {
  51326. "hide_name": 0,
  51327. "type": "SB_LUT4",
  51328. "parameters": {
  51329. "LUT_INIT": "1100110011110000"
  51330. },
  51331. "attributes": {
  51332. "module_not_derived": "00000000000000000000000000000001",
  51333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51334. },
  51335. "port_directions": {
  51336. "I0": "input",
  51337. "I1": "input",
  51338. "I2": "input",
  51339. "I3": "input",
  51340. "O": "output"
  51341. },
  51342. "connections": {
  51343. "I0": [ "0" ],
  51344. "I1": [ 2151 ],
  51345. "I2": [ 2250 ],
  51346. "I3": [ 2094 ],
  51347. "O": [ 2251 ]
  51348. }
  51349. },
  51350. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_5_SB_LUT4_I1": {
  51351. "hide_name": 0,
  51352. "type": "SB_LUT4",
  51353. "parameters": {
  51354. "LUT_INIT": "1111000011001100"
  51355. },
  51356. "attributes": {
  51357. "module_not_derived": "00000000000000000000000000000001",
  51358. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51359. },
  51360. "port_directions": {
  51361. "I0": "input",
  51362. "I1": "input",
  51363. "I2": "input",
  51364. "I3": "input",
  51365. "O": "output"
  51366. },
  51367. "connections": {
  51368. "I0": [ "0" ],
  51369. "I1": [ 2234 ],
  51370. "I2": [ 2179 ],
  51371. "I3": [ 2089 ],
  51372. "O": [ 2252 ]
  51373. }
  51374. },
  51375. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2": {
  51376. "hide_name": 0,
  51377. "type": "SB_LUT4",
  51378. "parameters": {
  51379. "LUT_INIT": "1100110011110000"
  51380. },
  51381. "attributes": {
  51382. "module_not_derived": "00000000000000000000000000000001",
  51383. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51384. },
  51385. "port_directions": {
  51386. "I0": "input",
  51387. "I1": "input",
  51388. "I2": "input",
  51389. "I3": "input",
  51390. "O": "output"
  51391. },
  51392. "connections": {
  51393. "I0": [ "0" ],
  51394. "I1": [ 2150 ],
  51395. "I2": [ 2252 ],
  51396. "I3": [ 2094 ],
  51397. "O": [ 2253 ]
  51398. }
  51399. },
  51400. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_6_SB_LUT4_I1": {
  51401. "hide_name": 0,
  51402. "type": "SB_LUT4",
  51403. "parameters": {
  51404. "LUT_INIT": "1111000011001100"
  51405. },
  51406. "attributes": {
  51407. "module_not_derived": "00000000000000000000000000000001",
  51408. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51409. },
  51410. "port_directions": {
  51411. "I0": "input",
  51412. "I1": "input",
  51413. "I2": "input",
  51414. "I3": "input",
  51415. "O": "output"
  51416. },
  51417. "connections": {
  51418. "I0": [ "0" ],
  51419. "I1": [ 2233 ],
  51420. "I2": [ 2180 ],
  51421. "I3": [ 2089 ],
  51422. "O": [ 2254 ]
  51423. }
  51424. },
  51425. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_6_SB_LUT4_I1_O_SB_LUT4_I2": {
  51426. "hide_name": 0,
  51427. "type": "SB_LUT4",
  51428. "parameters": {
  51429. "LUT_INIT": "1100110011110000"
  51430. },
  51431. "attributes": {
  51432. "module_not_derived": "00000000000000000000000000000001",
  51433. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51434. },
  51435. "port_directions": {
  51436. "I0": "input",
  51437. "I1": "input",
  51438. "I2": "input",
  51439. "I3": "input",
  51440. "O": "output"
  51441. },
  51442. "connections": {
  51443. "I0": [ "0" ],
  51444. "I1": [ 2149 ],
  51445. "I2": [ 2254 ],
  51446. "I3": [ 2094 ],
  51447. "O": [ 2255 ]
  51448. }
  51449. },
  51450. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_7_SB_LUT4_I1": {
  51451. "hide_name": 0,
  51452. "type": "SB_LUT4",
  51453. "parameters": {
  51454. "LUT_INIT": "1111000011001100"
  51455. },
  51456. "attributes": {
  51457. "module_not_derived": "00000000000000000000000000000001",
  51458. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51459. },
  51460. "port_directions": {
  51461. "I0": "input",
  51462. "I1": "input",
  51463. "I2": "input",
  51464. "I3": "input",
  51465. "O": "output"
  51466. },
  51467. "connections": {
  51468. "I0": [ "0" ],
  51469. "I1": [ 2232 ],
  51470. "I2": [ 2181 ],
  51471. "I3": [ 2089 ],
  51472. "O": [ 2256 ]
  51473. }
  51474. },
  51475. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I2": {
  51476. "hide_name": 0,
  51477. "type": "SB_LUT4",
  51478. "parameters": {
  51479. "LUT_INIT": "1100110011110000"
  51480. },
  51481. "attributes": {
  51482. "module_not_derived": "00000000000000000000000000000001",
  51483. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51484. },
  51485. "port_directions": {
  51486. "I0": "input",
  51487. "I1": "input",
  51488. "I2": "input",
  51489. "I3": "input",
  51490. "O": "output"
  51491. },
  51492. "connections": {
  51493. "I0": [ "0" ],
  51494. "I1": [ 2148 ],
  51495. "I2": [ 2256 ],
  51496. "I3": [ 2094 ],
  51497. "O": [ 2257 ]
  51498. }
  51499. },
  51500. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_8_SB_DFF_Q": {
  51501. "hide_name": 0,
  51502. "type": "SB_DFF",
  51503. "parameters": {
  51504. },
  51505. "attributes": {
  51506. "module_not_derived": "00000000000000000000000000000001",
  51507. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51508. },
  51509. "port_directions": {
  51510. "C": "input",
  51511. "D": "input",
  51512. "Q": "output"
  51513. },
  51514. "connections": {
  51515. "C": [ 42 ],
  51516. "D": [ 2147 ],
  51517. "Q": [ 2182 ]
  51518. }
  51519. },
  51520. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_9_SB_DFF_Q": {
  51521. "hide_name": 0,
  51522. "type": "SB_DFF",
  51523. "parameters": {
  51524. },
  51525. "attributes": {
  51526. "module_not_derived": "00000000000000000000000000000001",
  51527. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51528. },
  51529. "port_directions": {
  51530. "C": "input",
  51531. "D": "input",
  51532. "Q": "output"
  51533. },
  51534. "connections": {
  51535. "C": [ 42 ],
  51536. "D": [ 2146 ],
  51537. "Q": [ 2185 ]
  51538. }
  51539. },
  51540. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_SB_DFF_Q": {
  51541. "hide_name": 0,
  51542. "type": "SB_DFF",
  51543. "parameters": {
  51544. },
  51545. "attributes": {
  51546. "module_not_derived": "00000000000000000000000000000001",
  51547. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51548. },
  51549. "port_directions": {
  51550. "C": "input",
  51551. "D": "input",
  51552. "Q": "output"
  51553. },
  51554. "connections": {
  51555. "C": [ 42 ],
  51556. "D": [ 2155 ],
  51557. "Q": [ 2188 ]
  51558. }
  51559. },
  51560. "cpu_I.RegFilePlugin_shadow_write_SB_DFFR_Q": {
  51561. "hide_name": 0,
  51562. "type": "SB_DFFR",
  51563. "parameters": {
  51564. },
  51565. "attributes": {
  51566. "module_not_derived": "00000000000000000000000000000001",
  51567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  51568. },
  51569. "port_directions": {
  51570. "C": "input",
  51571. "D": "input",
  51572. "Q": "output",
  51573. "R": "input"
  51574. },
  51575. "connections": {
  51576. "C": [ 42 ],
  51577. "D": [ 2258 ],
  51578. "Q": [ 2259 ],
  51579. "R": [ 127 ]
  51580. }
  51581. },
  51582. "cpu_I.RegFilePlugin_shadow_write_SB_DFF_D": {
  51583. "hide_name": 0,
  51584. "type": "SB_DFF",
  51585. "parameters": {
  51586. },
  51587. "attributes": {
  51588. "module_not_derived": "00000000000000000000000000000001",
  51589. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51590. },
  51591. "port_directions": {
  51592. "C": "input",
  51593. "D": "input",
  51594. "Q": "output"
  51595. },
  51596. "connections": {
  51597. "C": [ 42 ],
  51598. "D": [ 2259 ],
  51599. "Q": [ 2057 ]
  51600. }
  51601. },
  51602. "cpu_I.RegFilePlugin_shadow_write_SB_DFF_D_Q_SB_LUT4_I1": {
  51603. "hide_name": 0,
  51604. "type": "SB_LUT4",
  51605. "parameters": {
  51606. "LUT_INIT": "1100000000110000"
  51607. },
  51608. "attributes": {
  51609. "module_not_derived": "00000000000000000000000000000001",
  51610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51611. },
  51612. "port_directions": {
  51613. "I0": "input",
  51614. "I1": "input",
  51615. "I2": "input",
  51616. "I3": "input",
  51617. "O": "output"
  51618. },
  51619. "connections": {
  51620. "I0": [ "0" ],
  51621. "I1": [ 2057 ],
  51622. "I2": [ 2058 ],
  51623. "I3": [ 2035 ],
  51624. "O": [ 2161 ]
  51625. }
  51626. },
  51627. "cpu_I.RegFilePlugin_shadow_write_SB_DFF_D_Q_SB_LUT4_I1_O_SB_LUT4_O": {
  51628. "hide_name": 0,
  51629. "type": "SB_LUT4",
  51630. "parameters": {
  51631. "LUT_INIT": "1111000011001100"
  51632. },
  51633. "attributes": {
  51634. "module_not_derived": "00000000000000000000000000000001",
  51635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  51636. },
  51637. "port_directions": {
  51638. "I0": "input",
  51639. "I1": "input",
  51640. "I2": "input",
  51641. "I3": "input",
  51642. "O": "output"
  51643. },
  51644. "connections": {
  51645. "I0": [ "0" ],
  51646. "I1": [ 1535 ],
  51647. "I2": [ 1331 ],
  51648. "I3": [ 1475 ],
  51649. "O": [ 2191 ]
  51650. }
  51651. },
  51652. "cpu_I.RegFilePlugin_shadow_write_SB_DFF_D_Q_SB_LUT4_I1_O_SB_LUT4_O_1": {
  51653. "hide_name": 0,
  51654. "type": "SB_LUT4",
  51655. "parameters": {
  51656. "LUT_INIT": "0000111100000000"
  51657. },
  51658. "attributes": {
  51659. "module_not_derived": "00000000000000000000000000000001",
  51660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  51661. },
  51662. "port_directions": {
  51663. "I0": "input",
  51664. "I1": "input",
  51665. "I2": "input",
  51666. "I3": "input",
  51667. "O": "output"
  51668. },
  51669. "connections": {
  51670. "I0": [ "0" ],
  51671. "I1": [ "0" ],
  51672. "I2": [ 2053 ],
  51673. "I3": [ 2192 ],
  51674. "O": [ 2221 ]
  51675. }
  51676. },
  51677. "cpu_I.RegFilePlugin_shadow_write_SB_LUT4_I0": {
  51678. "hide_name": 0,
  51679. "type": "SB_LUT4",
  51680. "parameters": {
  51681. "LUT_INIT": "1111001000000010"
  51682. },
  51683. "attributes": {
  51684. "module_not_derived": "00000000000000000000000000000001",
  51685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  51686. },
  51687. "port_directions": {
  51688. "I0": "input",
  51689. "I1": "input",
  51690. "I2": "input",
  51691. "I3": "input",
  51692. "O": "output"
  51693. },
  51694. "connections": {
  51695. "I0": [ 2259 ],
  51696. "I1": [ 2260 ],
  51697. "I2": [ 2261 ],
  51698. "I3": [ 2262 ],
  51699. "O": [ 2258 ]
  51700. }
  51701. },
  51702. "cpu_I._zz_104__SB_DFFE_Q": {
  51703. "hide_name": 0,
  51704. "type": "SB_DFFE",
  51705. "parameters": {
  51706. },
  51707. "attributes": {
  51708. "module_not_derived": "00000000000000000000000000000001",
  51709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  51710. },
  51711. "port_directions": {
  51712. "C": "input",
  51713. "D": "input",
  51714. "E": "input",
  51715. "Q": "output"
  51716. },
  51717. "connections": {
  51718. "C": [ 42 ],
  51719. "D": [ 1821 ],
  51720. "E": [ 2263 ],
  51721. "Q": [ 943 ]
  51722. }
  51723. },
  51724. "cpu_I._zz_114__SB_DFF_Q": {
  51725. "hide_name": 0,
  51726. "type": "SB_DFF",
  51727. "parameters": {
  51728. },
  51729. "attributes": {
  51730. "module_not_derived": "00000000000000000000000000000001",
  51731. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51732. },
  51733. "port_directions": {
  51734. "C": "input",
  51735. "D": "input",
  51736. "Q": "output"
  51737. },
  51738. "connections": {
  51739. "C": [ 42 ],
  51740. "D": [ 2264 ],
  51741. "Q": [ 2056 ]
  51742. }
  51743. },
  51744. "cpu_I._zz_114__SB_DFF_Q_1": {
  51745. "hide_name": 0,
  51746. "type": "SB_DFF",
  51747. "parameters": {
  51748. },
  51749. "attributes": {
  51750. "module_not_derived": "00000000000000000000000000000001",
  51751. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51752. },
  51753. "port_directions": {
  51754. "C": "input",
  51755. "D": "input",
  51756. "Q": "output"
  51757. },
  51758. "connections": {
  51759. "C": [ 42 ],
  51760. "D": [ 2265 ],
  51761. "Q": [ 2055 ]
  51762. }
  51763. },
  51764. "cpu_I._zz_114__SB_DFF_Q_2": {
  51765. "hide_name": 0,
  51766. "type": "SB_DFF",
  51767. "parameters": {
  51768. },
  51769. "attributes": {
  51770. "module_not_derived": "00000000000000000000000000000001",
  51771. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51772. },
  51773. "port_directions": {
  51774. "C": "input",
  51775. "D": "input",
  51776. "Q": "output"
  51777. },
  51778. "connections": {
  51779. "C": [ 42 ],
  51780. "D": [ 2266 ],
  51781. "Q": [ 2054 ]
  51782. }
  51783. },
  51784. "cpu_I._zz_114__SB_DFF_Q_3": {
  51785. "hide_name": 0,
  51786. "type": "SB_DFF",
  51787. "parameters": {
  51788. },
  51789. "attributes": {
  51790. "module_not_derived": "00000000000000000000000000000001",
  51791. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51792. },
  51793. "port_directions": {
  51794. "C": "input",
  51795. "D": "input",
  51796. "Q": "output"
  51797. },
  51798. "connections": {
  51799. "C": [ 42 ],
  51800. "D": [ 2267 ],
  51801. "Q": [ 2053 ]
  51802. }
  51803. },
  51804. "cpu_I._zz_114__SB_DFF_Q_4": {
  51805. "hide_name": 0,
  51806. "type": "SB_DFF",
  51807. "parameters": {
  51808. },
  51809. "attributes": {
  51810. "module_not_derived": "00000000000000000000000000000001",
  51811. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51812. },
  51813. "port_directions": {
  51814. "C": "input",
  51815. "D": "input",
  51816. "Q": "output"
  51817. },
  51818. "connections": {
  51819. "C": [ 42 ],
  51820. "D": [ 2268 ],
  51821. "Q": [ 2052 ]
  51822. }
  51823. },
  51824. "cpu_I._zz_115__SB_DFF_Q": {
  51825. "hide_name": 0,
  51826. "type": "SB_DFF",
  51827. "parameters": {
  51828. },
  51829. "attributes": {
  51830. "module_not_derived": "00000000000000000000000000000001",
  51831. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51832. },
  51833. "port_directions": {
  51834. "C": "input",
  51835. "D": "input",
  51836. "Q": "output"
  51837. },
  51838. "connections": {
  51839. "C": [ 42 ],
  51840. "D": [ 2269 ],
  51841. "Q": [ 2155 ]
  51842. }
  51843. },
  51844. "cpu_I._zz_115__SB_DFF_Q_1": {
  51845. "hide_name": 0,
  51846. "type": "SB_DFF",
  51847. "parameters": {
  51848. },
  51849. "attributes": {
  51850. "module_not_derived": "00000000000000000000000000000001",
  51851. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51852. },
  51853. "port_directions": {
  51854. "C": "input",
  51855. "D": "input",
  51856. "Q": "output"
  51857. },
  51858. "connections": {
  51859. "C": [ 42 ],
  51860. "D": [ 2270 ],
  51861. "Q": [ 2147 ]
  51862. }
  51863. },
  51864. "cpu_I._zz_115__SB_DFF_Q_10": {
  51865. "hide_name": 0,
  51866. "type": "SB_DFF",
  51867. "parameters": {
  51868. },
  51869. "attributes": {
  51870. "module_not_derived": "00000000000000000000000000000001",
  51871. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51872. },
  51873. "port_directions": {
  51874. "C": "input",
  51875. "D": "input",
  51876. "Q": "output"
  51877. },
  51878. "connections": {
  51879. "C": [ 42 ],
  51880. "D": [ 2271 ],
  51881. "Q": [ 2150 ]
  51882. }
  51883. },
  51884. "cpu_I._zz_115__SB_DFF_Q_11": {
  51885. "hide_name": 0,
  51886. "type": "SB_DFF",
  51887. "parameters": {
  51888. },
  51889. "attributes": {
  51890. "module_not_derived": "00000000000000000000000000000001",
  51891. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51892. },
  51893. "port_directions": {
  51894. "C": "input",
  51895. "D": "input",
  51896. "Q": "output"
  51897. },
  51898. "connections": {
  51899. "C": [ 42 ],
  51900. "D": [ 2272 ],
  51901. "Q": [ 2142 ]
  51902. }
  51903. },
  51904. "cpu_I._zz_115__SB_DFF_Q_12": {
  51905. "hide_name": 0,
  51906. "type": "SB_DFF",
  51907. "parameters": {
  51908. },
  51909. "attributes": {
  51910. "module_not_derived": "00000000000000000000000000000001",
  51911. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51912. },
  51913. "port_directions": {
  51914. "C": "input",
  51915. "D": "input",
  51916. "Q": "output"
  51917. },
  51918. "connections": {
  51919. "C": [ 42 ],
  51920. "D": [ 2273 ],
  51921. "Q": [ 2152 ]
  51922. }
  51923. },
  51924. "cpu_I._zz_115__SB_DFF_Q_13": {
  51925. "hide_name": 0,
  51926. "type": "SB_DFF",
  51927. "parameters": {
  51928. },
  51929. "attributes": {
  51930. "module_not_derived": "00000000000000000000000000000001",
  51931. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51932. },
  51933. "port_directions": {
  51934. "C": "input",
  51935. "D": "input",
  51936. "Q": "output"
  51937. },
  51938. "connections": {
  51939. "C": [ 42 ],
  51940. "D": [ 2274 ],
  51941. "Q": [ 2144 ]
  51942. }
  51943. },
  51944. "cpu_I._zz_115__SB_DFF_Q_14": {
  51945. "hide_name": 0,
  51946. "type": "SB_DFF",
  51947. "parameters": {
  51948. },
  51949. "attributes": {
  51950. "module_not_derived": "00000000000000000000000000000001",
  51951. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51952. },
  51953. "port_directions": {
  51954. "C": "input",
  51955. "D": "input",
  51956. "Q": "output"
  51957. },
  51958. "connections": {
  51959. "C": [ 42 ],
  51960. "D": [ 2275 ],
  51961. "Q": [ 2148 ]
  51962. }
  51963. },
  51964. "cpu_I._zz_115__SB_DFF_Q_15": {
  51965. "hide_name": 0,
  51966. "type": "SB_DFF",
  51967. "parameters": {
  51968. },
  51969. "attributes": {
  51970. "module_not_derived": "00000000000000000000000000000001",
  51971. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51972. },
  51973. "port_directions": {
  51974. "C": "input",
  51975. "D": "input",
  51976. "Q": "output"
  51977. },
  51978. "connections": {
  51979. "C": [ 42 ],
  51980. "D": [ 2276 ],
  51981. "Q": [ 2140 ]
  51982. }
  51983. },
  51984. "cpu_I._zz_115__SB_DFF_Q_16": {
  51985. "hide_name": 0,
  51986. "type": "SB_DFF",
  51987. "parameters": {
  51988. },
  51989. "attributes": {
  51990. "module_not_derived": "00000000000000000000000000000001",
  51991. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  51992. },
  51993. "port_directions": {
  51994. "C": "input",
  51995. "D": "input",
  51996. "Q": "output"
  51997. },
  51998. "connections": {
  51999. "C": [ 42 ],
  52000. "D": [ 2277 ],
  52001. "Q": [ 2074 ]
  52002. }
  52003. },
  52004. "cpu_I._zz_115__SB_DFF_Q_17": {
  52005. "hide_name": 0,
  52006. "type": "SB_DFF",
  52007. "parameters": {
  52008. },
  52009. "attributes": {
  52010. "module_not_derived": "00000000000000000000000000000001",
  52011. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52012. },
  52013. "port_directions": {
  52014. "C": "input",
  52015. "D": "input",
  52016. "Q": "output"
  52017. },
  52018. "connections": {
  52019. "C": [ 42 ],
  52020. "D": [ 2278 ],
  52021. "Q": [ 2066 ]
  52022. }
  52023. },
  52024. "cpu_I._zz_115__SB_DFF_Q_18": {
  52025. "hide_name": 0,
  52026. "type": "SB_DFF",
  52027. "parameters": {
  52028. },
  52029. "attributes": {
  52030. "module_not_derived": "00000000000000000000000000000001",
  52031. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52032. },
  52033. "port_directions": {
  52034. "C": "input",
  52035. "D": "input",
  52036. "Q": "output"
  52037. },
  52038. "connections": {
  52039. "C": [ 42 ],
  52040. "D": [ 2279 ],
  52041. "Q": [ 2070 ]
  52042. }
  52043. },
  52044. "cpu_I._zz_115__SB_DFF_Q_19": {
  52045. "hide_name": 0,
  52046. "type": "SB_DFF",
  52047. "parameters": {
  52048. },
  52049. "attributes": {
  52050. "module_not_derived": "00000000000000000000000000000001",
  52051. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52052. },
  52053. "port_directions": {
  52054. "C": "input",
  52055. "D": "input",
  52056. "Q": "output"
  52057. },
  52058. "connections": {
  52059. "C": [ 42 ],
  52060. "D": [ 2280 ],
  52061. "Q": [ 2062 ]
  52062. }
  52063. },
  52064. "cpu_I._zz_115__SB_DFF_Q_2": {
  52065. "hide_name": 0,
  52066. "type": "SB_DFF",
  52067. "parameters": {
  52068. },
  52069. "attributes": {
  52070. "module_not_derived": "00000000000000000000000000000001",
  52071. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52072. },
  52073. "port_directions": {
  52074. "C": "input",
  52075. "D": "input",
  52076. "Q": "output"
  52077. },
  52078. "connections": {
  52079. "C": [ 42 ],
  52080. "D": [ 2281 ],
  52081. "Q": [ 2151 ]
  52082. }
  52083. },
  52084. "cpu_I._zz_115__SB_DFF_Q_20": {
  52085. "hide_name": 0,
  52086. "type": "SB_DFF",
  52087. "parameters": {
  52088. },
  52089. "attributes": {
  52090. "module_not_derived": "00000000000000000000000000000001",
  52091. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52092. },
  52093. "port_directions": {
  52094. "C": "input",
  52095. "D": "input",
  52096. "Q": "output"
  52097. },
  52098. "connections": {
  52099. "C": [ 42 ],
  52100. "D": [ 2282 ],
  52101. "Q": [ 2072 ]
  52102. }
  52103. },
  52104. "cpu_I._zz_115__SB_DFF_Q_21": {
  52105. "hide_name": 0,
  52106. "type": "SB_DFF",
  52107. "parameters": {
  52108. },
  52109. "attributes": {
  52110. "module_not_derived": "00000000000000000000000000000001",
  52111. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52112. },
  52113. "port_directions": {
  52114. "C": "input",
  52115. "D": "input",
  52116. "Q": "output"
  52117. },
  52118. "connections": {
  52119. "C": [ 42 ],
  52120. "D": [ 2283 ],
  52121. "Q": [ 2064 ]
  52122. }
  52123. },
  52124. "cpu_I._zz_115__SB_DFF_Q_22": {
  52125. "hide_name": 0,
  52126. "type": "SB_DFF",
  52127. "parameters": {
  52128. },
  52129. "attributes": {
  52130. "module_not_derived": "00000000000000000000000000000001",
  52131. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52132. },
  52133. "port_directions": {
  52134. "C": "input",
  52135. "D": "input",
  52136. "Q": "output"
  52137. },
  52138. "connections": {
  52139. "C": [ 42 ],
  52140. "D": [ 2284 ],
  52141. "Q": [ 2068 ]
  52142. }
  52143. },
  52144. "cpu_I._zz_115__SB_DFF_Q_23": {
  52145. "hide_name": 0,
  52146. "type": "SB_DFF",
  52147. "parameters": {
  52148. },
  52149. "attributes": {
  52150. "module_not_derived": "00000000000000000000000000000001",
  52151. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52152. },
  52153. "port_directions": {
  52154. "C": "input",
  52155. "D": "input",
  52156. "Q": "output"
  52157. },
  52158. "connections": {
  52159. "C": [ 42 ],
  52160. "D": [ 2285 ],
  52161. "Q": [ 2060 ]
  52162. }
  52163. },
  52164. "cpu_I._zz_115__SB_DFF_Q_24": {
  52165. "hide_name": 0,
  52166. "type": "SB_DFF",
  52167. "parameters": {
  52168. },
  52169. "attributes": {
  52170. "module_not_derived": "00000000000000000000000000000001",
  52171. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52172. },
  52173. "port_directions": {
  52174. "C": "input",
  52175. "D": "input",
  52176. "Q": "output"
  52177. },
  52178. "connections": {
  52179. "C": [ 42 ],
  52180. "D": [ 2286 ],
  52181. "Q": [ 2073 ]
  52182. }
  52183. },
  52184. "cpu_I._zz_115__SB_DFF_Q_25": {
  52185. "hide_name": 0,
  52186. "type": "SB_DFF",
  52187. "parameters": {
  52188. },
  52189. "attributes": {
  52190. "module_not_derived": "00000000000000000000000000000001",
  52191. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52192. },
  52193. "port_directions": {
  52194. "C": "input",
  52195. "D": "input",
  52196. "Q": "output"
  52197. },
  52198. "connections": {
  52199. "C": [ 42 ],
  52200. "D": [ 2287 ],
  52201. "Q": [ 2065 ]
  52202. }
  52203. },
  52204. "cpu_I._zz_115__SB_DFF_Q_26": {
  52205. "hide_name": 0,
  52206. "type": "SB_DFF",
  52207. "parameters": {
  52208. },
  52209. "attributes": {
  52210. "module_not_derived": "00000000000000000000000000000001",
  52211. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52212. },
  52213. "port_directions": {
  52214. "C": "input",
  52215. "D": "input",
  52216. "Q": "output"
  52217. },
  52218. "connections": {
  52219. "C": [ 42 ],
  52220. "D": [ 2288 ],
  52221. "Q": [ 2069 ]
  52222. }
  52223. },
  52224. "cpu_I._zz_115__SB_DFF_Q_27": {
  52225. "hide_name": 0,
  52226. "type": "SB_DFF",
  52227. "parameters": {
  52228. },
  52229. "attributes": {
  52230. "module_not_derived": "00000000000000000000000000000001",
  52231. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52232. },
  52233. "port_directions": {
  52234. "C": "input",
  52235. "D": "input",
  52236. "Q": "output"
  52237. },
  52238. "connections": {
  52239. "C": [ 42 ],
  52240. "D": [ 2289 ],
  52241. "Q": [ 2061 ]
  52242. }
  52243. },
  52244. "cpu_I._zz_115__SB_DFF_Q_28": {
  52245. "hide_name": 0,
  52246. "type": "SB_DFF",
  52247. "parameters": {
  52248. },
  52249. "attributes": {
  52250. "module_not_derived": "00000000000000000000000000000001",
  52251. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52252. },
  52253. "port_directions": {
  52254. "C": "input",
  52255. "D": "input",
  52256. "Q": "output"
  52257. },
  52258. "connections": {
  52259. "C": [ 42 ],
  52260. "D": [ 2290 ],
  52261. "Q": [ 2071 ]
  52262. }
  52263. },
  52264. "cpu_I._zz_115__SB_DFF_Q_29": {
  52265. "hide_name": 0,
  52266. "type": "SB_DFF",
  52267. "parameters": {
  52268. },
  52269. "attributes": {
  52270. "module_not_derived": "00000000000000000000000000000001",
  52271. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52272. },
  52273. "port_directions": {
  52274. "C": "input",
  52275. "D": "input",
  52276. "Q": "output"
  52277. },
  52278. "connections": {
  52279. "C": [ 42 ],
  52280. "D": [ 2291 ],
  52281. "Q": [ 2063 ]
  52282. }
  52283. },
  52284. "cpu_I._zz_115__SB_DFF_Q_3": {
  52285. "hide_name": 0,
  52286. "type": "SB_DFF",
  52287. "parameters": {
  52288. },
  52289. "attributes": {
  52290. "module_not_derived": "00000000000000000000000000000001",
  52291. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52292. },
  52293. "port_directions": {
  52294. "C": "input",
  52295. "D": "input",
  52296. "Q": "output"
  52297. },
  52298. "connections": {
  52299. "C": [ 42 ],
  52300. "D": [ 2292 ],
  52301. "Q": [ 2143 ]
  52302. }
  52303. },
  52304. "cpu_I._zz_115__SB_DFF_Q_30": {
  52305. "hide_name": 0,
  52306. "type": "SB_DFF",
  52307. "parameters": {
  52308. },
  52309. "attributes": {
  52310. "module_not_derived": "00000000000000000000000000000001",
  52311. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52312. },
  52313. "port_directions": {
  52314. "C": "input",
  52315. "D": "input",
  52316. "Q": "output"
  52317. },
  52318. "connections": {
  52319. "C": [ 42 ],
  52320. "D": [ 2293 ],
  52321. "Q": [ 2067 ]
  52322. }
  52323. },
  52324. "cpu_I._zz_115__SB_DFF_Q_31": {
  52325. "hide_name": 0,
  52326. "type": "SB_DFF",
  52327. "parameters": {
  52328. },
  52329. "attributes": {
  52330. "module_not_derived": "00000000000000000000000000000001",
  52331. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52332. },
  52333. "port_directions": {
  52334. "C": "input",
  52335. "D": "input",
  52336. "Q": "output"
  52337. },
  52338. "connections": {
  52339. "C": [ 42 ],
  52340. "D": [ 2294 ],
  52341. "Q": [ 2059 ]
  52342. }
  52343. },
  52344. "cpu_I._zz_115__SB_DFF_Q_4": {
  52345. "hide_name": 0,
  52346. "type": "SB_DFF",
  52347. "parameters": {
  52348. },
  52349. "attributes": {
  52350. "module_not_derived": "00000000000000000000000000000001",
  52351. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52352. },
  52353. "port_directions": {
  52354. "C": "input",
  52355. "D": "input",
  52356. "Q": "output"
  52357. },
  52358. "connections": {
  52359. "C": [ 42 ],
  52360. "D": [ 2295 ],
  52361. "Q": [ 2153 ]
  52362. }
  52363. },
  52364. "cpu_I._zz_115__SB_DFF_Q_5": {
  52365. "hide_name": 0,
  52366. "type": "SB_DFF",
  52367. "parameters": {
  52368. },
  52369. "attributes": {
  52370. "module_not_derived": "00000000000000000000000000000001",
  52371. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52372. },
  52373. "port_directions": {
  52374. "C": "input",
  52375. "D": "input",
  52376. "Q": "output"
  52377. },
  52378. "connections": {
  52379. "C": [ 42 ],
  52380. "D": [ 2296 ],
  52381. "Q": [ 2145 ]
  52382. }
  52383. },
  52384. "cpu_I._zz_115__SB_DFF_Q_6": {
  52385. "hide_name": 0,
  52386. "type": "SB_DFF",
  52387. "parameters": {
  52388. },
  52389. "attributes": {
  52390. "module_not_derived": "00000000000000000000000000000001",
  52391. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52392. },
  52393. "port_directions": {
  52394. "C": "input",
  52395. "D": "input",
  52396. "Q": "output"
  52397. },
  52398. "connections": {
  52399. "C": [ 42 ],
  52400. "D": [ 2297 ],
  52401. "Q": [ 2149 ]
  52402. }
  52403. },
  52404. "cpu_I._zz_115__SB_DFF_Q_7": {
  52405. "hide_name": 0,
  52406. "type": "SB_DFF",
  52407. "parameters": {
  52408. },
  52409. "attributes": {
  52410. "module_not_derived": "00000000000000000000000000000001",
  52411. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52412. },
  52413. "port_directions": {
  52414. "C": "input",
  52415. "D": "input",
  52416. "Q": "output"
  52417. },
  52418. "connections": {
  52419. "C": [ 42 ],
  52420. "D": [ 2298 ],
  52421. "Q": [ 2141 ]
  52422. }
  52423. },
  52424. "cpu_I._zz_115__SB_DFF_Q_8": {
  52425. "hide_name": 0,
  52426. "type": "SB_DFF",
  52427. "parameters": {
  52428. },
  52429. "attributes": {
  52430. "module_not_derived": "00000000000000000000000000000001",
  52431. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52432. },
  52433. "port_directions": {
  52434. "C": "input",
  52435. "D": "input",
  52436. "Q": "output"
  52437. },
  52438. "connections": {
  52439. "C": [ 42 ],
  52440. "D": [ 2299 ],
  52441. "Q": [ 2154 ]
  52442. }
  52443. },
  52444. "cpu_I._zz_115__SB_DFF_Q_9": {
  52445. "hide_name": 0,
  52446. "type": "SB_DFF",
  52447. "parameters": {
  52448. },
  52449. "attributes": {
  52450. "module_not_derived": "00000000000000000000000000000001",
  52451. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  52452. },
  52453. "port_directions": {
  52454. "C": "input",
  52455. "D": "input",
  52456. "Q": "output"
  52457. },
  52458. "connections": {
  52459. "C": [ 42 ],
  52460. "D": [ 2300 ],
  52461. "Q": [ 2146 ]
  52462. }
  52463. },
  52464. "cpu_I._zz_169__SB_DFFR_D": {
  52465. "hide_name": 0,
  52466. "type": "SB_DFFR",
  52467. "parameters": {
  52468. },
  52469. "attributes": {
  52470. "module_not_derived": "00000000000000000000000000000001",
  52471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  52472. },
  52473. "port_directions": {
  52474. "C": "input",
  52475. "D": "input",
  52476. "Q": "output",
  52477. "R": "input"
  52478. },
  52479. "connections": {
  52480. "C": [ 42 ],
  52481. "D": [ 2301 ],
  52482. "Q": [ 2302 ],
  52483. "R": [ 127 ]
  52484. }
  52485. },
  52486. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2": {
  52487. "hide_name": 0,
  52488. "type": "SB_LUT4",
  52489. "parameters": {
  52490. "LUT_INIT": "0000000010010000"
  52491. },
  52492. "attributes": {
  52493. "module_not_derived": "00000000000000000000000000000001",
  52494. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52495. },
  52496. "port_directions": {
  52497. "I0": "input",
  52498. "I1": "input",
  52499. "I2": "input",
  52500. "I3": "input",
  52501. "O": "output"
  52502. },
  52503. "connections": {
  52504. "I0": [ 1532 ],
  52505. "I1": [ 2055 ],
  52506. "I2": [ 2302 ],
  52507. "I3": [ 2303 ],
  52508. "O": [ 2092 ]
  52509. }
  52510. },
  52511. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_I3_SB_LUT4_O": {
  52512. "hide_name": 0,
  52513. "type": "SB_LUT4",
  52514. "parameters": {
  52515. "LUT_INIT": "0000111100000000"
  52516. },
  52517. "attributes": {
  52518. "module_not_derived": "00000000000000000000000000000001",
  52519. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  52520. },
  52521. "port_directions": {
  52522. "I0": "input",
  52523. "I1": "input",
  52524. "I2": "input",
  52525. "I3": "input",
  52526. "O": "output"
  52527. },
  52528. "connections": {
  52529. "I0": [ "0" ],
  52530. "I1": [ "0" ],
  52531. "I2": [ 1531 ],
  52532. "I3": [ 2056 ],
  52533. "O": [ 2303 ]
  52534. }
  52535. },
  52536. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_O_SB_LUT4_O": {
  52537. "hide_name": 0,
  52538. "type": "SB_LUT4",
  52539. "parameters": {
  52540. "LUT_INIT": "0000000000001001"
  52541. },
  52542. "attributes": {
  52543. "module_not_derived": "00000000000000000000000000000001",
  52544. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52545. },
  52546. "port_directions": {
  52547. "I0": "input",
  52548. "I1": "input",
  52549. "I2": "input",
  52550. "I3": "input",
  52551. "O": "output"
  52552. },
  52553. "connections": {
  52554. "I0": [ 1534 ],
  52555. "I1": [ 2053 ],
  52556. "I2": [ 2304 ],
  52557. "I3": [ 2305 ],
  52558. "O": [ 2093 ]
  52559. }
  52560. },
  52561. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_O_SB_LUT4_O_1": {
  52562. "hide_name": 0,
  52563. "type": "SB_LUT4",
  52564. "parameters": {
  52565. "LUT_INIT": "1100010000110001"
  52566. },
  52567. "attributes": {
  52568. "module_not_derived": "00000000000000000000000000000001",
  52569. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52570. },
  52571. "port_directions": {
  52572. "I0": "input",
  52573. "I1": "input",
  52574. "I2": "input",
  52575. "I3": "input",
  52576. "O": "output"
  52577. },
  52578. "connections": {
  52579. "I0": [ 1533 ],
  52580. "I1": [ 1535 ],
  52581. "I2": [ 2054 ],
  52582. "I3": [ 2052 ],
  52583. "O": [ 2091 ]
  52584. }
  52585. },
  52586. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_O_SB_LUT4_O_I2_SB_LUT4_O": {
  52587. "hide_name": 0,
  52588. "type": "SB_LUT4",
  52589. "parameters": {
  52590. "LUT_INIT": "0000111100000000"
  52591. },
  52592. "attributes": {
  52593. "module_not_derived": "00000000000000000000000000000001",
  52594. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  52595. },
  52596. "port_directions": {
  52597. "I0": "input",
  52598. "I1": "input",
  52599. "I2": "input",
  52600. "I3": "input",
  52601. "O": "output"
  52602. },
  52603. "connections": {
  52604. "I0": [ "0" ],
  52605. "I1": [ "0" ],
  52606. "I2": [ 1533 ],
  52607. "I3": [ 2054 ],
  52608. "O": [ 2304 ]
  52609. }
  52610. },
  52611. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_O_SB_LUT4_O_I2_SB_LUT4_O_1": {
  52612. "hide_name": 0,
  52613. "type": "SB_LUT4",
  52614. "parameters": {
  52615. "LUT_INIT": "0000000011110000"
  52616. },
  52617. "attributes": {
  52618. "module_not_derived": "00000000000000000000000000000001",
  52619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  52620. },
  52621. "port_directions": {
  52622. "I0": "input",
  52623. "I1": "input",
  52624. "I2": "input",
  52625. "I3": "input",
  52626. "O": "output"
  52627. },
  52628. "connections": {
  52629. "I0": [ "0" ],
  52630. "I1": [ "0" ],
  52631. "I2": [ 1531 ],
  52632. "I3": [ 2056 ],
  52633. "O": [ 2305 ]
  52634. }
  52635. },
  52636. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3": {
  52637. "hide_name": 0,
  52638. "type": "SB_LUT4",
  52639. "parameters": {
  52640. "LUT_INIT": "1100111100000000"
  52641. },
  52642. "attributes": {
  52643. "module_not_derived": "00000000000000000000000000000001",
  52644. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  52645. },
  52646. "port_directions": {
  52647. "I0": "input",
  52648. "I1": "input",
  52649. "I2": "input",
  52650. "I3": "input",
  52651. "O": "output"
  52652. },
  52653. "connections": {
  52654. "I0": [ "0" ],
  52655. "I1": [ 1551 ],
  52656. "I2": [ 2054 ],
  52657. "I3": [ 2302 ],
  52658. "O": [ 2306 ]
  52659. }
  52660. },
  52661. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_I2": {
  52662. "hide_name": 0,
  52663. "type": "SB_LUT4",
  52664. "parameters": {
  52665. "LUT_INIT": "1001000000000000"
  52666. },
  52667. "attributes": {
  52668. "module_not_derived": "00000000000000000000000000000001",
  52669. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52670. },
  52671. "port_directions": {
  52672. "I0": "input",
  52673. "I1": "input",
  52674. "I2": "input",
  52675. "I3": "input",
  52676. "O": "output"
  52677. },
  52678. "connections": {
  52679. "I0": [ 1530 ],
  52680. "I1": [ 2052 ],
  52681. "I2": [ 2306 ],
  52682. "I3": [ 2307 ],
  52683. "O": [ 2080 ]
  52684. }
  52685. },
  52686. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  52687. "hide_name": 0,
  52688. "type": "SB_LUT4",
  52689. "parameters": {
  52690. "LUT_INIT": "1111000011001100"
  52691. },
  52692. "attributes": {
  52693. "module_not_derived": "00000000000000000000000000000001",
  52694. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  52695. },
  52696. "port_directions": {
  52697. "I0": "input",
  52698. "I1": "input",
  52699. "I2": "input",
  52700. "I3": "input",
  52701. "O": "output"
  52702. },
  52703. "connections": {
  52704. "I0": [ "0" ],
  52705. "I1": [ 2129 ],
  52706. "I2": [ 2157 ],
  52707. "I3": [ 2078 ],
  52708. "O": [ 2308 ]
  52709. }
  52710. },
  52711. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_O": {
  52712. "hide_name": 0,
  52713. "type": "SB_LUT4",
  52714. "parameters": {
  52715. "LUT_INIT": "1001000000000000"
  52716. },
  52717. "attributes": {
  52718. "module_not_derived": "00000000000000000000000000000001",
  52719. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52720. },
  52721. "port_directions": {
  52722. "I0": "input",
  52723. "I1": "input",
  52724. "I2": "input",
  52725. "I3": "input",
  52726. "O": "output"
  52727. },
  52728. "connections": {
  52729. "I0": [ 1552 ],
  52730. "I1": [ 2053 ],
  52731. "I2": [ 2309 ],
  52732. "I3": [ 2310 ],
  52733. "O": [ 2307 ]
  52734. }
  52735. },
  52736. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_O_I2_SB_LUT4_O": {
  52737. "hide_name": 0,
  52738. "type": "SB_LUT4",
  52739. "parameters": {
  52740. "LUT_INIT": "1010111100100011"
  52741. },
  52742. "attributes": {
  52743. "module_not_derived": "00000000000000000000000000000001",
  52744. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52745. },
  52746. "port_directions": {
  52747. "I0": "input",
  52748. "I1": "input",
  52749. "I2": "input",
  52750. "I3": "input",
  52751. "O": "output"
  52752. },
  52753. "connections": {
  52754. "I0": [ 1550 ],
  52755. "I1": [ 1551 ],
  52756. "I2": [ 2055 ],
  52757. "I3": [ 2054 ],
  52758. "O": [ 2309 ]
  52759. }
  52760. },
  52761. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_O_I2_SB_LUT4_O_1": {
  52762. "hide_name": 0,
  52763. "type": "SB_LUT4",
  52764. "parameters": {
  52765. "LUT_INIT": "1010010100100001"
  52766. },
  52767. "attributes": {
  52768. "module_not_derived": "00000000000000000000000000000001",
  52769. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52770. },
  52771. "port_directions": {
  52772. "I0": "input",
  52773. "I1": "input",
  52774. "I2": "input",
  52775. "I3": "input",
  52776. "O": "output"
  52777. },
  52778. "connections": {
  52779. "I0": [ 1549 ],
  52780. "I1": [ 1550 ],
  52781. "I2": [ 2056 ],
  52782. "I3": [ 2055 ],
  52783. "O": [ 2310 ]
  52784. }
  52785. },
  52786. "cpu_I._zz_169__SB_DFFSS_D": {
  52787. "hide_name": 0,
  52788. "type": "SB_DFFSS",
  52789. "parameters": {
  52790. },
  52791. "attributes": {
  52792. "module_not_derived": "00000000000000000000000000000001",
  52793. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  52794. },
  52795. "port_directions": {
  52796. "C": "input",
  52797. "D": "input",
  52798. "Q": "output",
  52799. "S": "input"
  52800. },
  52801. "connections": {
  52802. "C": [ 42 ],
  52803. "D": [ 2301 ],
  52804. "Q": [ 2058 ],
  52805. "S": [ 2311 ]
  52806. }
  52807. },
  52808. "cpu_I._zz_169__SB_DFFSS_D_Q_SB_LUT4_I3": {
  52809. "hide_name": 0,
  52810. "type": "SB_LUT4",
  52811. "parameters": {
  52812. "LUT_INIT": "0000000011111111"
  52813. },
  52814. "attributes": {
  52815. "module_not_derived": "00000000000000000000000000000001",
  52816. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  52817. },
  52818. "port_directions": {
  52819. "I0": "input",
  52820. "I1": "input",
  52821. "I2": "input",
  52822. "I3": "input",
  52823. "O": "output"
  52824. },
  52825. "connections": {
  52826. "I0": [ "0" ],
  52827. "I1": [ "0" ],
  52828. "I2": [ "0" ],
  52829. "I3": [ 2058 ],
  52830. "O": [ 2029 ]
  52831. }
  52832. },
  52833. "cpu_I._zz_169__SB_DFFSS_D_S_SB_DFFS_Q": {
  52834. "hide_name": 0,
  52835. "type": "SB_DFFS",
  52836. "parameters": {
  52837. },
  52838. "attributes": {
  52839. "module_not_derived": "00000000000000000000000000000001",
  52840. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  52841. },
  52842. "port_directions": {
  52843. "C": "input",
  52844. "D": "input",
  52845. "Q": "output",
  52846. "S": "input"
  52847. },
  52848. "connections": {
  52849. "C": [ 42 ],
  52850. "D": [ "0" ],
  52851. "Q": [ 2311 ],
  52852. "S": [ 127 ]
  52853. }
  52854. },
  52855. "cpu_I._zz_169__SB_LUT4_I3": {
  52856. "hide_name": 0,
  52857. "type": "SB_LUT4",
  52858. "parameters": {
  52859. "LUT_INIT": "1100111100000000"
  52860. },
  52861. "attributes": {
  52862. "module_not_derived": "00000000000000000000000000000001",
  52863. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  52864. },
  52865. "port_directions": {
  52866. "I0": "input",
  52867. "I1": "input",
  52868. "I2": "input",
  52869. "I3": "input",
  52870. "O": "output"
  52871. },
  52872. "connections": {
  52873. "I0": [ "0" ],
  52874. "I1": [ 1535 ],
  52875. "I2": [ 2268 ],
  52876. "I3": [ 2301 ],
  52877. "O": [ 2312 ]
  52878. }
  52879. },
  52880. "cpu_I._zz_169__SB_LUT4_I3_1": {
  52881. "hide_name": 0,
  52882. "type": "SB_LUT4",
  52883. "parameters": {
  52884. "LUT_INIT": "0000100100000000"
  52885. },
  52886. "attributes": {
  52887. "module_not_derived": "00000000000000000000000000000001",
  52888. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52889. },
  52890. "port_directions": {
  52891. "I0": "input",
  52892. "I1": "input",
  52893. "I2": "input",
  52894. "I3": "input",
  52895. "O": "output"
  52896. },
  52897. "connections": {
  52898. "I0": [ 1551 ],
  52899. "I1": [ 2266 ],
  52900. "I2": [ 2313 ],
  52901. "I3": [ 2301 ],
  52902. "O": [ 2314 ]
  52903. }
  52904. },
  52905. "cpu_I._zz_169__SB_LUT4_I3_1_I2_SB_LUT4_O": {
  52906. "hide_name": 0,
  52907. "type": "SB_LUT4",
  52908. "parameters": {
  52909. "LUT_INIT": "0000000011110000"
  52910. },
  52911. "attributes": {
  52912. "module_not_derived": "00000000000000000000000000000001",
  52913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  52914. },
  52915. "port_directions": {
  52916. "I0": "input",
  52917. "I1": "input",
  52918. "I2": "input",
  52919. "I3": "input",
  52920. "O": "output"
  52921. },
  52922. "connections": {
  52923. "I0": [ "0" ],
  52924. "I1": [ "0" ],
  52925. "I2": [ 1530 ],
  52926. "I3": [ 2268 ],
  52927. "O": [ 2313 ]
  52928. }
  52929. },
  52930. "cpu_I._zz_169__SB_LUT4_I3_1_O_SB_LUT4_I0": {
  52931. "hide_name": 0,
  52932. "type": "SB_LUT4",
  52933. "parameters": {
  52934. "LUT_INIT": "1000000000000000"
  52935. },
  52936. "attributes": {
  52937. "module_not_derived": "00000000000000000000000000000001",
  52938. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52939. },
  52940. "port_directions": {
  52941. "I0": "input",
  52942. "I1": "input",
  52943. "I2": "input",
  52944. "I3": "input",
  52945. "O": "output"
  52946. },
  52947. "connections": {
  52948. "I0": [ 2315 ],
  52949. "I1": [ 2316 ],
  52950. "I2": [ 2317 ],
  52951. "I3": [ 2314 ],
  52952. "O": [ 2112 ]
  52953. }
  52954. },
  52955. "cpu_I._zz_169__SB_LUT4_I3_1_O_SB_LUT4_I0_O_SB_LUT4_O": {
  52956. "hide_name": 0,
  52957. "type": "SB_LUT4",
  52958. "parameters": {
  52959. "LUT_INIT": "1100110011110000"
  52960. },
  52961. "attributes": {
  52962. "module_not_derived": "00000000000000000000000000000001",
  52963. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  52964. },
  52965. "port_directions": {
  52966. "I0": "input",
  52967. "I1": "input",
  52968. "I2": "input",
  52969. "I3": "input",
  52970. "O": "output"
  52971. },
  52972. "connections": {
  52973. "I0": [ "0" ],
  52974. "I1": [ 2145 ],
  52975. "I2": [ 2308 ],
  52976. "I3": [ 2080 ],
  52977. "O": [ 2318 ]
  52978. }
  52979. },
  52980. "cpu_I._zz_169__SB_LUT4_I3_1_O_SB_LUT4_O": {
  52981. "hide_name": 0,
  52982. "type": "SB_LUT4",
  52983. "parameters": {
  52984. "LUT_INIT": "1010111100100011"
  52985. },
  52986. "attributes": {
  52987. "module_not_derived": "00000000000000000000000000000001",
  52988. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  52989. },
  52990. "port_directions": {
  52991. "I0": "input",
  52992. "I1": "input",
  52993. "I2": "input",
  52994. "I3": "input",
  52995. "O": "output"
  52996. },
  52997. "connections": {
  52998. "I0": [ 1549 ],
  52999. "I1": [ 1552 ],
  53000. "I2": [ 2264 ],
  53001. "I3": [ 2267 ],
  53002. "O": [ 2315 ]
  53003. }
  53004. },
  53005. "cpu_I._zz_169__SB_LUT4_I3_1_O_SB_LUT4_O_1": {
  53006. "hide_name": 0,
  53007. "type": "SB_LUT4",
  53008. "parameters": {
  53009. "LUT_INIT": "1000010010100101"
  53010. },
  53011. "attributes": {
  53012. "module_not_derived": "00000000000000000000000000000001",
  53013. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53014. },
  53015. "port_directions": {
  53016. "I0": "input",
  53017. "I1": "input",
  53018. "I2": "input",
  53019. "I3": "input",
  53020. "O": "output"
  53021. },
  53022. "connections": {
  53023. "I0": [ 1550 ],
  53024. "I1": [ 1552 ],
  53025. "I2": [ 2265 ],
  53026. "I3": [ 2267 ],
  53027. "O": [ 2316 ]
  53028. }
  53029. },
  53030. "cpu_I._zz_169__SB_LUT4_I3_1_O_SB_LUT4_O_2": {
  53031. "hide_name": 0,
  53032. "type": "SB_LUT4",
  53033. "parameters": {
  53034. "LUT_INIT": "1100010011110101"
  53035. },
  53036. "attributes": {
  53037. "module_not_derived": "00000000000000000000000000000001",
  53038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53039. },
  53040. "port_directions": {
  53041. "I0": "input",
  53042. "I1": "input",
  53043. "I2": "input",
  53044. "I3": "input",
  53045. "O": "output"
  53046. },
  53047. "connections": {
  53048. "I0": [ 1549 ],
  53049. "I1": [ 1530 ],
  53050. "I2": [ 2264 ],
  53051. "I3": [ 2268 ],
  53052. "O": [ 2317 ]
  53053. }
  53054. },
  53055. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2": {
  53056. "hide_name": 0,
  53057. "type": "SB_LUT4",
  53058. "parameters": {
  53059. "LUT_INIT": "1001000000000000"
  53060. },
  53061. "attributes": {
  53062. "module_not_derived": "00000000000000000000000000000001",
  53063. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53064. },
  53065. "port_directions": {
  53066. "I0": "input",
  53067. "I1": "input",
  53068. "I2": "input",
  53069. "I3": "input",
  53070. "O": "output"
  53071. },
  53072. "connections": {
  53073. "I0": [ 1533 ],
  53074. "I1": [ 2266 ],
  53075. "I2": [ 2319 ],
  53076. "I3": [ 2312 ],
  53077. "O": [ 2320 ]
  53078. }
  53079. },
  53080. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_I1": {
  53081. "hide_name": 0,
  53082. "type": "SB_LUT4",
  53083. "parameters": {
  53084. "LUT_INIT": "1100000000000000"
  53085. },
  53086. "attributes": {
  53087. "module_not_derived": "00000000000000000000000000000001",
  53088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53089. },
  53090. "port_directions": {
  53091. "I0": "input",
  53092. "I1": "input",
  53093. "I2": "input",
  53094. "I3": "input",
  53095. "O": "output"
  53096. },
  53097. "connections": {
  53098. "I0": [ "0" ],
  53099. "I1": [ 2321 ],
  53100. "I2": [ 2322 ],
  53101. "I3": [ 2320 ],
  53102. "O": [ 2323 ]
  53103. }
  53104. },
  53105. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_I1_O_SB_LUT4_O": {
  53106. "hide_name": 0,
  53107. "type": "SB_LUT4",
  53108. "parameters": {
  53109. "LUT_INIT": "0011001111110000"
  53110. },
  53111. "attributes": {
  53112. "module_not_derived": "00000000000000000000000000000001",
  53113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53114. },
  53115. "port_directions": {
  53116. "I0": "input",
  53117. "I1": "input",
  53118. "I2": "input",
  53119. "I3": "input",
  53120. "O": "output"
  53121. },
  53122. "connections": {
  53123. "I0": [ "0" ],
  53124. "I1": [ 2059 ],
  53125. "I2": [ 2090 ],
  53126. "I3": [ 2094 ],
  53127. "O": [ 2324 ]
  53128. }
  53129. },
  53130. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  53131. "hide_name": 0,
  53132. "type": "SB_LUT4",
  53133. "parameters": {
  53134. "LUT_INIT": "1100010011110101"
  53135. },
  53136. "attributes": {
  53137. "module_not_derived": "00000000000000000000000000000001",
  53138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53139. },
  53140. "port_directions": {
  53141. "I0": "input",
  53142. "I1": "input",
  53143. "I2": "input",
  53144. "I3": "input",
  53145. "O": "output"
  53146. },
  53147. "connections": {
  53148. "I0": [ 1531 ],
  53149. "I1": [ 1534 ],
  53150. "I2": [ 2264 ],
  53151. "I3": [ 2267 ],
  53152. "O": [ 2321 ]
  53153. }
  53154. },
  53155. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_1": {
  53156. "hide_name": 0,
  53157. "type": "SB_LUT4",
  53158. "parameters": {
  53159. "LUT_INIT": "1010010100100001"
  53160. },
  53161. "attributes": {
  53162. "module_not_derived": "00000000000000000000000000000001",
  53163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53164. },
  53165. "port_directions": {
  53166. "I0": "input",
  53167. "I1": "input",
  53168. "I2": "input",
  53169. "I3": "input",
  53170. "O": "output"
  53171. },
  53172. "connections": {
  53173. "I0": [ 1532 ],
  53174. "I1": [ 1535 ],
  53175. "I2": [ 2265 ],
  53176. "I3": [ 2268 ],
  53177. "O": [ 2322 ]
  53178. }
  53179. },
  53180. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_O": {
  53181. "hide_name": 0,
  53182. "type": "SB_LUT4",
  53183. "parameters": {
  53184. "LUT_INIT": "1010111100100011"
  53185. },
  53186. "attributes": {
  53187. "module_not_derived": "00000000000000000000000000000001",
  53188. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53189. },
  53190. "port_directions": {
  53191. "I0": "input",
  53192. "I1": "input",
  53193. "I2": "input",
  53194. "I3": "input",
  53195. "O": "output"
  53196. },
  53197. "connections": {
  53198. "I0": [ 1531 ],
  53199. "I1": [ 1534 ],
  53200. "I2": [ 2264 ],
  53201. "I3": [ 2267 ],
  53202. "O": [ 2319 ]
  53203. }
  53204. },
  53205. "cpu_I._zz_169__SB_LUT4_O": {
  53206. "hide_name": 0,
  53207. "type": "SB_LUT4",
  53208. "parameters": {
  53209. "LUT_INIT": "1111000000000000"
  53210. },
  53211. "attributes": {
  53212. "module_not_derived": "00000000000000000000000000000001",
  53213. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  53214. },
  53215. "port_directions": {
  53216. "I0": "input",
  53217. "I1": "input",
  53218. "I2": "input",
  53219. "I3": "input",
  53220. "O": "output"
  53221. },
  53222. "connections": {
  53223. "I0": [ "0" ],
  53224. "I1": [ "0" ],
  53225. "I2": [ 2325 ],
  53226. "I3": [ 2326 ],
  53227. "O": [ 2301 ]
  53228. }
  53229. },
  53230. "cpu_I._zz_196__SB_DFFE_Q": {
  53231. "hide_name": 0,
  53232. "type": "SB_DFFE",
  53233. "parameters": {
  53234. },
  53235. "attributes": {
  53236. "module_not_derived": "00000000000000000000000000000001",
  53237. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  53238. },
  53239. "port_directions": {
  53240. "C": "input",
  53241. "D": "input",
  53242. "E": "input",
  53243. "Q": "output"
  53244. },
  53245. "connections": {
  53246. "C": [ 42 ],
  53247. "D": [ 1537 ],
  53248. "E": [ 2263 ],
  53249. "Q": [ 964 ]
  53250. }
  53251. },
  53252. "cpu_I._zz_198__SB_LUT4_O": {
  53253. "hide_name": 0,
  53254. "type": "SB_LUT4",
  53255. "parameters": {
  53256. "LUT_INIT": "0000000011111111"
  53257. },
  53258. "attributes": {
  53259. "module_not_derived": "00000000000000000000000000000001",
  53260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  53261. },
  53262. "port_directions": {
  53263. "I0": "input",
  53264. "I1": "input",
  53265. "I2": "input",
  53266. "I3": "input",
  53267. "O": "output"
  53268. },
  53269. "connections": {
  53270. "I0": [ "0" ],
  53271. "I1": [ "0" ],
  53272. "I2": [ "0" ],
  53273. "I3": [ 1362 ],
  53274. "O": [ 2327 ]
  53275. }
  53276. },
  53277. "cpu_I._zz_1__SB_LUT4_O": {
  53278. "hide_name": 0,
  53279. "type": "SB_LUT4",
  53280. "parameters": {
  53281. "LUT_INIT": "1111000111110000"
  53282. },
  53283. "attributes": {
  53284. "module_not_derived": "00000000000000000000000000000001",
  53285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53286. },
  53287. "port_directions": {
  53288. "I0": "input",
  53289. "I1": "input",
  53290. "I2": "input",
  53291. "I3": "input",
  53292. "O": "output"
  53293. },
  53294. "connections": {
  53295. "I0": [ 1363 ],
  53296. "I1": [ 1543 ],
  53297. "I2": [ 2328 ],
  53298. "I3": [ 2329 ],
  53299. "O": [ 2330 ]
  53300. }
  53301. },
  53302. "cpu_I._zz_1__SB_LUT4_O_1": {
  53303. "hide_name": 0,
  53304. "type": "SB_LUT4",
  53305. "parameters": {
  53306. "LUT_INIT": "1111000011111111"
  53307. },
  53308. "attributes": {
  53309. "module_not_derived": "00000000000000000000000000000001",
  53310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  53311. },
  53312. "port_directions": {
  53313. "I0": "input",
  53314. "I1": "input",
  53315. "I2": "input",
  53316. "I3": "input",
  53317. "O": "output"
  53318. },
  53319. "connections": {
  53320. "I0": [ "0" ],
  53321. "I1": [ "0" ],
  53322. "I2": [ 2328 ],
  53323. "I3": [ 2329 ],
  53324. "O": [ 2331 ]
  53325. }
  53326. },
  53327. "cpu_I._zz_209__SB_LUT4_O": {
  53328. "hide_name": 0,
  53329. "type": "SB_LUT4",
  53330. "parameters": {
  53331. "LUT_INIT": "1111111111110000"
  53332. },
  53333. "attributes": {
  53334. "module_not_derived": "00000000000000000000000000000001",
  53335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  53336. },
  53337. "port_directions": {
  53338. "I0": "input",
  53339. "I1": "input",
  53340. "I2": "input",
  53341. "I3": "input",
  53342. "O": "output"
  53343. },
  53344. "connections": {
  53345. "I0": [ "0" ],
  53346. "I1": [ "0" ],
  53347. "I2": [ 2328 ],
  53348. "I3": [ 2332 ],
  53349. "O": [ 2333 ]
  53350. }
  53351. },
  53352. "cpu_I._zz_209__SB_LUT4_O_I3_SB_LUT4_O": {
  53353. "hide_name": 0,
  53354. "type": "SB_LUT4",
  53355. "parameters": {
  53356. "LUT_INIT": "0000000100001011"
  53357. },
  53358. "attributes": {
  53359. "module_not_derived": "00000000000000000000000000000001",
  53360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53361. },
  53362. "port_directions": {
  53363. "I0": "input",
  53364. "I1": "input",
  53365. "I2": "input",
  53366. "I3": "input",
  53367. "O": "output"
  53368. },
  53369. "connections": {
  53370. "I0": [ 1537 ],
  53371. "I1": [ 1362 ],
  53372. "I2": [ 2334 ],
  53373. "I3": [ 2335 ],
  53374. "O": [ 2332 ]
  53375. }
  53376. },
  53377. "cpu_I._zz_210__SB_LUT4_O": {
  53378. "hide_name": 0,
  53379. "type": "SB_LUT4",
  53380. "parameters": {
  53381. "LUT_INIT": "1111110000000000"
  53382. },
  53383. "attributes": {
  53384. "module_not_derived": "00000000000000000000000000000001",
  53385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53386. },
  53387. "port_directions": {
  53388. "I0": "input",
  53389. "I1": "input",
  53390. "I2": "input",
  53391. "I3": "input",
  53392. "O": "output"
  53393. },
  53394. "connections": {
  53395. "I0": [ "0" ],
  53396. "I1": [ 1537 ],
  53397. "I2": [ 1362 ],
  53398. "I3": [ 2336 ],
  53399. "O": [ 2337 ]
  53400. }
  53401. },
  53402. "cpu_I._zz_210__SB_LUT4_O_I3_SB_LUT4_O": {
  53403. "hide_name": 0,
  53404. "type": "SB_LUT4",
  53405. "parameters": {
  53406. "LUT_INIT": "1111000000000000"
  53407. },
  53408. "attributes": {
  53409. "module_not_derived": "00000000000000000000000000000001",
  53410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  53411. },
  53412. "port_directions": {
  53413. "I0": "input",
  53414. "I1": "input",
  53415. "I2": "input",
  53416. "I3": "input",
  53417. "O": "output"
  53418. },
  53419. "connections": {
  53420. "I0": [ "0" ],
  53421. "I1": [ "0" ],
  53422. "I2": [ 1363 ],
  53423. "I3": [ 1543 ],
  53424. "O": [ 2336 ]
  53425. }
  53426. },
  53427. "cpu_I._zz_211__SB_LUT4_O": {
  53428. "hide_name": 0,
  53429. "type": "SB_LUT4",
  53430. "parameters": {
  53431. "LUT_INIT": "1000111111111111"
  53432. },
  53433. "attributes": {
  53434. "module_not_derived": "00000000000000000000000000000001",
  53435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53436. },
  53437. "port_directions": {
  53438. "I0": "input",
  53439. "I1": "input",
  53440. "I2": "input",
  53441. "I3": "input",
  53442. "O": "output"
  53443. },
  53444. "connections": {
  53445. "I0": [ 1536 ],
  53446. "I1": [ 2329 ],
  53447. "I2": [ 2338 ],
  53448. "I3": [ 2334 ],
  53449. "O": [ 2339 ]
  53450. }
  53451. },
  53452. "cpu_I._zz_212__SB_LUT4_O": {
  53453. "hide_name": 0,
  53454. "type": "SB_LUT4",
  53455. "parameters": {
  53456. "LUT_INIT": "0101000011011100"
  53457. },
  53458. "attributes": {
  53459. "module_not_derived": "00000000000000000000000000000001",
  53460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53461. },
  53462. "port_directions": {
  53463. "I0": "input",
  53464. "I1": "input",
  53465. "I2": "input",
  53466. "I3": "input",
  53467. "O": "output"
  53468. },
  53469. "connections": {
  53470. "I0": [ 1536 ],
  53471. "I1": [ 1537 ],
  53472. "I2": [ 1362 ],
  53473. "I3": [ 1543 ],
  53474. "O": [ 2340 ]
  53475. }
  53476. },
  53477. "cpu_I._zz_213__SB_LUT4_O": {
  53478. "hide_name": 0,
  53479. "type": "SB_LUT4",
  53480. "parameters": {
  53481. "LUT_INIT": "1000000000000000"
  53482. },
  53483. "attributes": {
  53484. "module_not_derived": "00000000000000000000000000000001",
  53485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53486. },
  53487. "port_directions": {
  53488. "I0": "input",
  53489. "I1": "input",
  53490. "I2": "input",
  53491. "I3": "input",
  53492. "O": "output"
  53493. },
  53494. "connections": {
  53495. "I0": [ 1548 ],
  53496. "I1": [ 1536 ],
  53497. "I2": [ 2329 ],
  53498. "I3": [ 2338 ],
  53499. "O": [ 2341 ]
  53500. }
  53501. },
  53502. "cpu_I._zz_213__SB_LUT4_O_I3_SB_LUT4_I3": {
  53503. "hide_name": 0,
  53504. "type": "SB_LUT4",
  53505. "parameters": {
  53506. "LUT_INIT": "0000000011111100"
  53507. },
  53508. "attributes": {
  53509. "module_not_derived": "00000000000000000000000000000001",
  53510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53511. },
  53512. "port_directions": {
  53513. "I0": "input",
  53514. "I1": "input",
  53515. "I2": "input",
  53516. "I3": "input",
  53517. "O": "output"
  53518. },
  53519. "connections": {
  53520. "I0": [ "0" ],
  53521. "I1": [ 1543 ],
  53522. "I2": [ 1364 ],
  53523. "I3": [ 2338 ],
  53524. "O": [ 2342 ]
  53525. }
  53526. },
  53527. "cpu_I._zz_213__SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  53528. "hide_name": 0,
  53529. "type": "SB_LUT4",
  53530. "parameters": {
  53531. "LUT_INIT": "0000000000110000"
  53532. },
  53533. "attributes": {
  53534. "module_not_derived": "00000000000000000000000000000001",
  53535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53536. },
  53537. "port_directions": {
  53538. "I0": "input",
  53539. "I1": "input",
  53540. "I2": "input",
  53541. "I3": "input",
  53542. "O": "output"
  53543. },
  53544. "connections": {
  53545. "I0": [ "0" ],
  53546. "I1": [ 1536 ],
  53547. "I2": [ 1362 ],
  53548. "I3": [ 2328 ],
  53549. "O": [ 2343 ]
  53550. }
  53551. },
  53552. "cpu_I._zz_213__SB_LUT4_O_I3_SB_LUT4_O": {
  53553. "hide_name": 0,
  53554. "type": "SB_LUT4",
  53555. "parameters": {
  53556. "LUT_INIT": "0000000000001111"
  53557. },
  53558. "attributes": {
  53559. "module_not_derived": "00000000000000000000000000000001",
  53560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  53561. },
  53562. "port_directions": {
  53563. "I0": "input",
  53564. "I1": "input",
  53565. "I2": "input",
  53566. "I3": "input",
  53567. "O": "output"
  53568. },
  53569. "connections": {
  53570. "I0": [ "0" ],
  53571. "I1": [ "0" ],
  53572. "I2": [ 1363 ],
  53573. "I3": [ 2328 ],
  53574. "O": [ 2338 ]
  53575. }
  53576. },
  53577. "cpu_I._zz_215__SB_LUT4_O": {
  53578. "hide_name": 0,
  53579. "type": "SB_LUT4",
  53580. "parameters": {
  53581. "LUT_INIT": "1010100011111101"
  53582. },
  53583. "attributes": {
  53584. "module_not_derived": "00000000000000000000000000000001",
  53585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53586. },
  53587. "port_directions": {
  53588. "I0": "input",
  53589. "I1": "input",
  53590. "I2": "input",
  53591. "I3": "input",
  53592. "O": "output"
  53593. },
  53594. "connections": {
  53595. "I0": [ 2344 ],
  53596. "I1": [ 2345 ],
  53597. "I2": [ 2346 ],
  53598. "I3": [ 2347 ],
  53599. "O": [ 2348 ]
  53600. }
  53601. },
  53602. "cpu_I._zz_215__SB_LUT4_O_1": {
  53603. "hide_name": 0,
  53604. "type": "SB_LUT4",
  53605. "parameters": {
  53606. "LUT_INIT": "1010100011111101"
  53607. },
  53608. "attributes": {
  53609. "module_not_derived": "00000000000000000000000000000001",
  53610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  53611. },
  53612. "port_directions": {
  53613. "I0": "input",
  53614. "I1": "input",
  53615. "I2": "input",
  53616. "I3": "input",
  53617. "O": "output"
  53618. },
  53619. "connections": {
  53620. "I0": [ 2344 ],
  53621. "I1": [ 2349 ],
  53622. "I2": [ 2350 ],
  53623. "I3": [ 2351 ],
  53624. "O": [ 2352 ]
  53625. }
  53626. },
  53627. "cpu_I._zz_215__SB_LUT4_O_10": {
  53628. "hide_name": 0,
  53629. "type": "SB_LUT4",
  53630. "parameters": {
  53631. "LUT_INIT": "0011000011111100"
  53632. },
  53633. "attributes": {
  53634. "module_not_derived": "00000000000000000000000000000001",
  53635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53636. },
  53637. "port_directions": {
  53638. "I0": "input",
  53639. "I1": "input",
  53640. "I2": "input",
  53641. "I3": "input",
  53642. "O": "output"
  53643. },
  53644. "connections": {
  53645. "I0": [ "0" ],
  53646. "I1": [ 2344 ],
  53647. "I2": [ 2353 ],
  53648. "I3": [ 2354 ],
  53649. "O": [ 2355 ]
  53650. }
  53651. },
  53652. "cpu_I._zz_215__SB_LUT4_O_11": {
  53653. "hide_name": 0,
  53654. "type": "SB_LUT4",
  53655. "parameters": {
  53656. "LUT_INIT": "0011000011111100"
  53657. },
  53658. "attributes": {
  53659. "module_not_derived": "00000000000000000000000000000001",
  53660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53661. },
  53662. "port_directions": {
  53663. "I0": "input",
  53664. "I1": "input",
  53665. "I2": "input",
  53666. "I3": "input",
  53667. "O": "output"
  53668. },
  53669. "connections": {
  53670. "I0": [ "0" ],
  53671. "I1": [ 2344 ],
  53672. "I2": [ 2356 ],
  53673. "I3": [ 2357 ],
  53674. "O": [ 2358 ]
  53675. }
  53676. },
  53677. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O": {
  53678. "hide_name": 0,
  53679. "type": "SB_LUT4",
  53680. "parameters": {
  53681. "LUT_INIT": "1111001111000000"
  53682. },
  53683. "attributes": {
  53684. "module_not_derived": "00000000000000000000000000000001",
  53685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53686. },
  53687. "port_directions": {
  53688. "I0": "input",
  53689. "I1": "input",
  53690. "I2": "input",
  53691. "I3": "input",
  53692. "O": "output"
  53693. },
  53694. "connections": {
  53695. "I0": [ "0" ],
  53696. "I1": [ 2359 ],
  53697. "I2": [ 2360 ],
  53698. "I3": [ 2361 ],
  53699. "O": [ 2357 ]
  53700. }
  53701. },
  53702. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  53703. "hide_name": 0,
  53704. "type": "SB_LUT4",
  53705. "parameters": {
  53706. "LUT_INIT": "1111001111000000"
  53707. },
  53708. "attributes": {
  53709. "module_not_derived": "00000000000000000000000000000001",
  53710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53711. },
  53712. "port_directions": {
  53713. "I0": "input",
  53714. "I1": "input",
  53715. "I2": "input",
  53716. "I3": "input",
  53717. "O": "output"
  53718. },
  53719. "connections": {
  53720. "I0": [ "0" ],
  53721. "I1": [ 2362 ],
  53722. "I2": [ 2363 ],
  53723. "I3": [ 2364 ],
  53724. "O": [ 2360 ]
  53725. }
  53726. },
  53727. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I2": {
  53728. "hide_name": 0,
  53729. "type": "SB_LUT4",
  53730. "parameters": {
  53731. "LUT_INIT": "1111001111000000"
  53732. },
  53733. "attributes": {
  53734. "module_not_derived": "00000000000000000000000000000001",
  53735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53736. },
  53737. "port_directions": {
  53738. "I0": "input",
  53739. "I1": "input",
  53740. "I2": "input",
  53741. "I3": "input",
  53742. "O": "output"
  53743. },
  53744. "connections": {
  53745. "I0": [ "0" ],
  53746. "I1": [ 2362 ],
  53747. "I2": [ 2364 ],
  53748. "I3": [ 2365 ],
  53749. "O": [ 2366 ]
  53750. }
  53751. },
  53752. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  53753. "hide_name": 0,
  53754. "type": "SB_LUT4",
  53755. "parameters": {
  53756. "LUT_INIT": "1111110000110000"
  53757. },
  53758. "attributes": {
  53759. "module_not_derived": "00000000000000000000000000000001",
  53760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53761. },
  53762. "port_directions": {
  53763. "I0": "input",
  53764. "I1": "input",
  53765. "I2": "input",
  53766. "I3": "input",
  53767. "O": "output"
  53768. },
  53769. "connections": {
  53770. "I0": [ "0" ],
  53771. "I1": [ 2367 ],
  53772. "I2": [ 2368 ],
  53773. "I3": [ 2369 ],
  53774. "O": [ 2365 ]
  53775. }
  53776. },
  53777. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  53778. "hide_name": 0,
  53779. "type": "SB_LUT4",
  53780. "parameters": {
  53781. "LUT_INIT": "1111001111000000"
  53782. },
  53783. "attributes": {
  53784. "module_not_derived": "00000000000000000000000000000001",
  53785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53786. },
  53787. "port_directions": {
  53788. "I0": "input",
  53789. "I1": "input",
  53790. "I2": "input",
  53791. "I3": "input",
  53792. "O": "output"
  53793. },
  53794. "connections": {
  53795. "I0": [ "0" ],
  53796. "I1": [ 2367 ],
  53797. "I2": [ 2370 ],
  53798. "I3": [ 2371 ],
  53799. "O": [ 2364 ]
  53800. }
  53801. },
  53802. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  53803. "hide_name": 0,
  53804. "type": "SB_LUT4",
  53805. "parameters": {
  53806. "LUT_INIT": "1111110000110000"
  53807. },
  53808. "attributes": {
  53809. "module_not_derived": "00000000000000000000000000000001",
  53810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53811. },
  53812. "port_directions": {
  53813. "I0": "input",
  53814. "I1": "input",
  53815. "I2": "input",
  53816. "I3": "input",
  53817. "O": "output"
  53818. },
  53819. "connections": {
  53820. "I0": [ "0" ],
  53821. "I1": [ 2372 ],
  53822. "I2": [ 2373 ],
  53823. "I3": [ 2374 ],
  53824. "O": [ 2375 ]
  53825. }
  53826. },
  53827. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  53828. "hide_name": 0,
  53829. "type": "SB_LUT4",
  53830. "parameters": {
  53831. "LUT_INIT": "1111110000110000"
  53832. },
  53833. "attributes": {
  53834. "module_not_derived": "00000000000000000000000000000001",
  53835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53836. },
  53837. "port_directions": {
  53838. "I0": "input",
  53839. "I1": "input",
  53840. "I2": "input",
  53841. "I3": "input",
  53842. "O": "output"
  53843. },
  53844. "connections": {
  53845. "I0": [ "0" ],
  53846. "I1": [ 2372 ],
  53847. "I2": [ 2376 ],
  53848. "I3": [ 2377 ],
  53849. "O": [ 2368 ]
  53850. }
  53851. },
  53852. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  53853. "hide_name": 0,
  53854. "type": "SB_LUT4",
  53855. "parameters": {
  53856. "LUT_INIT": "0000001111001111"
  53857. },
  53858. "attributes": {
  53859. "module_not_derived": "00000000000000000000000000000001",
  53860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53861. },
  53862. "port_directions": {
  53863. "I0": "input",
  53864. "I1": "input",
  53865. "I2": "input",
  53866. "I3": "input",
  53867. "O": "output"
  53868. },
  53869. "connections": {
  53870. "I0": [ "0" ],
  53871. "I1": [ 2378 ],
  53872. "I2": [ 2379 ],
  53873. "I3": [ 2380 ],
  53874. "O": [ 2381 ]
  53875. }
  53876. },
  53877. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  53878. "hide_name": 0,
  53879. "type": "SB_LUT4",
  53880. "parameters": {
  53881. "LUT_INIT": "0000001111001111"
  53882. },
  53883. "attributes": {
  53884. "module_not_derived": "00000000000000000000000000000001",
  53885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53886. },
  53887. "port_directions": {
  53888. "I0": "input",
  53889. "I1": "input",
  53890. "I2": "input",
  53891. "I3": "input",
  53892. "O": "output"
  53893. },
  53894. "connections": {
  53895. "I0": [ "0" ],
  53896. "I1": [ 2378 ],
  53897. "I2": [ 2382 ],
  53898. "I3": [ 2383 ],
  53899. "O": [ 2373 ]
  53900. }
  53901. },
  53902. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  53903. "hide_name": 0,
  53904. "type": "SB_LUT4",
  53905. "parameters": {
  53906. "LUT_INIT": "0000001111001111"
  53907. },
  53908. "attributes": {
  53909. "module_not_derived": "00000000000000000000000000000001",
  53910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53911. },
  53912. "port_directions": {
  53913. "I0": "input",
  53914. "I1": "input",
  53915. "I2": "input",
  53916. "I3": "input",
  53917. "O": "output"
  53918. },
  53919. "connections": {
  53920. "I0": [ "0" ],
  53921. "I1": [ 2378 ],
  53922. "I2": [ 2384 ],
  53923. "I3": [ 2385 ],
  53924. "O": [ 2374 ]
  53925. }
  53926. },
  53927. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  53928. "hide_name": 0,
  53929. "type": "SB_LUT4",
  53930. "parameters": {
  53931. "LUT_INIT": "0000001111001111"
  53932. },
  53933. "attributes": {
  53934. "module_not_derived": "00000000000000000000000000000001",
  53935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53936. },
  53937. "port_directions": {
  53938. "I0": "input",
  53939. "I1": "input",
  53940. "I2": "input",
  53941. "I3": "input",
  53942. "O": "output"
  53943. },
  53944. "connections": {
  53945. "I0": [ "0" ],
  53946. "I1": [ 2378 ],
  53947. "I2": [ 2386 ],
  53948. "I3": [ 2387 ],
  53949. "O": [ 2376 ]
  53950. }
  53951. },
  53952. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  53953. "hide_name": 0,
  53954. "type": "SB_LUT4",
  53955. "parameters": {
  53956. "LUT_INIT": "1111110000110000"
  53957. },
  53958. "attributes": {
  53959. "module_not_derived": "00000000000000000000000000000001",
  53960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53961. },
  53962. "port_directions": {
  53963. "I0": "input",
  53964. "I1": "input",
  53965. "I2": "input",
  53966. "I3": "input",
  53967. "O": "output"
  53968. },
  53969. "connections": {
  53970. "I0": [ "0" ],
  53971. "I1": [ 2372 ],
  53972. "I2": [ 2388 ],
  53973. "I3": [ 2389 ],
  53974. "O": [ 2369 ]
  53975. }
  53976. },
  53977. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  53978. "hide_name": 0,
  53979. "type": "SB_LUT4",
  53980. "parameters": {
  53981. "LUT_INIT": "1111001111000000"
  53982. },
  53983. "attributes": {
  53984. "module_not_derived": "00000000000000000000000000000001",
  53985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  53986. },
  53987. "port_directions": {
  53988. "I0": "input",
  53989. "I1": "input",
  53990. "I2": "input",
  53991. "I3": "input",
  53992. "O": "output"
  53993. },
  53994. "connections": {
  53995. "I0": [ "0" ],
  53996. "I1": [ 2372 ],
  53997. "I2": [ 2390 ],
  53998. "I3": [ 2391 ],
  53999. "O": [ 2371 ]
  54000. }
  54001. },
  54002. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  54003. "hide_name": 0,
  54004. "type": "SB_LUT4",
  54005. "parameters": {
  54006. "LUT_INIT": "0000001111001111"
  54007. },
  54008. "attributes": {
  54009. "module_not_derived": "00000000000000000000000000000001",
  54010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54011. },
  54012. "port_directions": {
  54013. "I0": "input",
  54014. "I1": "input",
  54015. "I2": "input",
  54016. "I3": "input",
  54017. "O": "output"
  54018. },
  54019. "connections": {
  54020. "I0": [ "0" ],
  54021. "I1": [ 2378 ],
  54022. "I2": [ 2392 ],
  54023. "I3": [ 2393 ],
  54024. "O": [ 2377 ]
  54025. }
  54026. },
  54027. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  54028. "hide_name": 0,
  54029. "type": "SB_LUT4",
  54030. "parameters": {
  54031. "LUT_INIT": "0000001111001111"
  54032. },
  54033. "attributes": {
  54034. "module_not_derived": "00000000000000000000000000000001",
  54035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54036. },
  54037. "port_directions": {
  54038. "I0": "input",
  54039. "I1": "input",
  54040. "I2": "input",
  54041. "I3": "input",
  54042. "O": "output"
  54043. },
  54044. "connections": {
  54045. "I0": [ "0" ],
  54046. "I1": [ 2378 ],
  54047. "I2": [ 2394 ],
  54048. "I3": [ 2395 ],
  54049. "O": [ 2388 ]
  54050. }
  54051. },
  54052. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  54053. "hide_name": 0,
  54054. "type": "SB_LUT4",
  54055. "parameters": {
  54056. "LUT_INIT": "0000001111001111"
  54057. },
  54058. "attributes": {
  54059. "module_not_derived": "00000000000000000000000000000001",
  54060. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54061. },
  54062. "port_directions": {
  54063. "I0": "input",
  54064. "I1": "input",
  54065. "I2": "input",
  54066. "I3": "input",
  54067. "O": "output"
  54068. },
  54069. "connections": {
  54070. "I0": [ "0" ],
  54071. "I1": [ 2378 ],
  54072. "I2": [ 2396 ],
  54073. "I3": [ 2397 ],
  54074. "O": [ 2389 ]
  54075. }
  54076. },
  54077. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  54078. "hide_name": 0,
  54079. "type": "SB_LUT4",
  54080. "parameters": {
  54081. "LUT_INIT": "0000001111001111"
  54082. },
  54083. "attributes": {
  54084. "module_not_derived": "00000000000000000000000000000001",
  54085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54086. },
  54087. "port_directions": {
  54088. "I0": "input",
  54089. "I1": "input",
  54090. "I2": "input",
  54091. "I3": "input",
  54092. "O": "output"
  54093. },
  54094. "connections": {
  54095. "I0": [ "0" ],
  54096. "I1": [ 2378 ],
  54097. "I2": [ 2398 ],
  54098. "I3": [ 2399 ],
  54099. "O": [ 2391 ]
  54100. }
  54101. },
  54102. "cpu_I._zz_215__SB_LUT4_O_12": {
  54103. "hide_name": 0,
  54104. "type": "SB_LUT4",
  54105. "parameters": {
  54106. "LUT_INIT": "0011000011111100"
  54107. },
  54108. "attributes": {
  54109. "module_not_derived": "00000000000000000000000000000001",
  54110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54111. },
  54112. "port_directions": {
  54113. "I0": "input",
  54114. "I1": "input",
  54115. "I2": "input",
  54116. "I3": "input",
  54117. "O": "output"
  54118. },
  54119. "connections": {
  54120. "I0": [ "0" ],
  54121. "I1": [ 2344 ],
  54122. "I2": [ 2400 ],
  54123. "I3": [ 2401 ],
  54124. "O": [ 2402 ]
  54125. }
  54126. },
  54127. "cpu_I._zz_215__SB_LUT4_O_12_I3_SB_LUT4_O": {
  54128. "hide_name": 0,
  54129. "type": "SB_LUT4",
  54130. "parameters": {
  54131. "LUT_INIT": "1111001111000000"
  54132. },
  54133. "attributes": {
  54134. "module_not_derived": "00000000000000000000000000000001",
  54135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54136. },
  54137. "port_directions": {
  54138. "I0": "input",
  54139. "I1": "input",
  54140. "I2": "input",
  54141. "I3": "input",
  54142. "O": "output"
  54143. },
  54144. "connections": {
  54145. "I0": [ "0" ],
  54146. "I1": [ 2359 ],
  54147. "I2": [ 2403 ],
  54148. "I3": [ 2404 ],
  54149. "O": [ 2401 ]
  54150. }
  54151. },
  54152. "cpu_I._zz_215__SB_LUT4_O_12_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  54153. "hide_name": 0,
  54154. "type": "SB_LUT4",
  54155. "parameters": {
  54156. "LUT_INIT": "1111001111000000"
  54157. },
  54158. "attributes": {
  54159. "module_not_derived": "00000000000000000000000000000001",
  54160. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54161. },
  54162. "port_directions": {
  54163. "I0": "input",
  54164. "I1": "input",
  54165. "I2": "input",
  54166. "I3": "input",
  54167. "O": "output"
  54168. },
  54169. "connections": {
  54170. "I0": [ "0" ],
  54171. "I1": [ 2362 ],
  54172. "I2": [ 2405 ],
  54173. "I3": [ 2406 ],
  54174. "O": [ 2403 ]
  54175. }
  54176. },
  54177. "cpu_I._zz_215__SB_LUT4_O_12_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  54178. "hide_name": 0,
  54179. "type": "SB_LUT4",
  54180. "parameters": {
  54181. "LUT_INIT": "1111110000110000"
  54182. },
  54183. "attributes": {
  54184. "module_not_derived": "00000000000000000000000000000001",
  54185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54186. },
  54187. "port_directions": {
  54188. "I0": "input",
  54189. "I1": "input",
  54190. "I2": "input",
  54191. "I3": "input",
  54192. "O": "output"
  54193. },
  54194. "connections": {
  54195. "I0": [ "0" ],
  54196. "I1": [ 2367 ],
  54197. "I2": [ 2375 ],
  54198. "I3": [ 2368 ],
  54199. "O": [ 2407 ]
  54200. }
  54201. },
  54202. "cpu_I._zz_215__SB_LUT4_O_12_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  54203. "hide_name": 0,
  54204. "type": "SB_LUT4",
  54205. "parameters": {
  54206. "LUT_INIT": "1111001111000000"
  54207. },
  54208. "attributes": {
  54209. "module_not_derived": "00000000000000000000000000000001",
  54210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54211. },
  54212. "port_directions": {
  54213. "I0": "input",
  54214. "I1": "input",
  54215. "I2": "input",
  54216. "I3": "input",
  54217. "O": "output"
  54218. },
  54219. "connections": {
  54220. "I0": [ "0" ],
  54221. "I1": [ 2367 ],
  54222. "I2": [ 2371 ],
  54223. "I3": [ 2369 ],
  54224. "O": [ 2406 ]
  54225. }
  54226. },
  54227. "cpu_I._zz_215__SB_LUT4_O_13": {
  54228. "hide_name": 0,
  54229. "type": "SB_LUT4",
  54230. "parameters": {
  54231. "LUT_INIT": "0000111100000000"
  54232. },
  54233. "attributes": {
  54234. "module_not_derived": "00000000000000000000000000000001",
  54235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  54236. },
  54237. "port_directions": {
  54238. "I0": "input",
  54239. "I1": "input",
  54240. "I2": "input",
  54241. "I3": "input",
  54242. "O": "output"
  54243. },
  54244. "connections": {
  54245. "I0": [ "0" ],
  54246. "I1": [ "0" ],
  54247. "I2": [ 2408 ],
  54248. "I3": [ 2400 ],
  54249. "O": [ 2409 ]
  54250. }
  54251. },
  54252. "cpu_I._zz_215__SB_LUT4_O_13_I3_SB_LUT4_O": {
  54253. "hide_name": 0,
  54254. "type": "SB_LUT4",
  54255. "parameters": {
  54256. "LUT_INIT": "0000000011111000"
  54257. },
  54258. "attributes": {
  54259. "module_not_derived": "00000000000000000000000000000001",
  54260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  54261. },
  54262. "port_directions": {
  54263. "I0": "input",
  54264. "I1": "input",
  54265. "I2": "input",
  54266. "I3": "input",
  54267. "O": "output"
  54268. },
  54269. "connections": {
  54270. "I0": [ 2359 ],
  54271. "I1": [ 2362 ],
  54272. "I2": [ 2410 ],
  54273. "I3": [ 2411 ],
  54274. "O": [ 2400 ]
  54275. }
  54276. },
  54277. "cpu_I._zz_215__SB_LUT4_O_14": {
  54278. "hide_name": 0,
  54279. "type": "SB_LUT4",
  54280. "parameters": {
  54281. "LUT_INIT": "1111110000110000"
  54282. },
  54283. "attributes": {
  54284. "module_not_derived": "00000000000000000000000000000001",
  54285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54286. },
  54287. "port_directions": {
  54288. "I0": "input",
  54289. "I1": "input",
  54290. "I2": "input",
  54291. "I3": "input",
  54292. "O": "output"
  54293. },
  54294. "connections": {
  54295. "I0": [ "0" ],
  54296. "I1": [ 2344 ],
  54297. "I2": [ 2410 ],
  54298. "I3": [ 2412 ],
  54299. "O": [ 2413 ]
  54300. }
  54301. },
  54302. "cpu_I._zz_215__SB_LUT4_O_15": {
  54303. "hide_name": 0,
  54304. "type": "SB_LUT4",
  54305. "parameters": {
  54306. "LUT_INIT": "0000111100000011"
  54307. },
  54308. "attributes": {
  54309. "module_not_derived": "00000000000000000000000000000001",
  54310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54311. },
  54312. "port_directions": {
  54313. "I0": "input",
  54314. "I1": "input",
  54315. "I2": "input",
  54316. "I3": "input",
  54317. "O": "output"
  54318. },
  54319. "connections": {
  54320. "I0": [ "0" ],
  54321. "I1": [ 2344 ],
  54322. "I2": [ 2408 ],
  54323. "I3": [ 2356 ],
  54324. "O": [ 2414 ]
  54325. }
  54326. },
  54327. "cpu_I._zz_215__SB_LUT4_O_15_I3_SB_LUT4_O": {
  54328. "hide_name": 0,
  54329. "type": "SB_LUT4",
  54330. "parameters": {
  54331. "LUT_INIT": "0011000011111100"
  54332. },
  54333. "attributes": {
  54334. "module_not_derived": "00000000000000000000000000000001",
  54335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54336. },
  54337. "port_directions": {
  54338. "I0": "input",
  54339. "I1": "input",
  54340. "I2": "input",
  54341. "I3": "input",
  54342. "O": "output"
  54343. },
  54344. "connections": {
  54345. "I0": [ "0" ],
  54346. "I1": [ 2359 ],
  54347. "I2": [ 2410 ],
  54348. "I3": [ 2415 ],
  54349. "O": [ 2356 ]
  54350. }
  54351. },
  54352. "cpu_I._zz_215__SB_LUT4_O_16": {
  54353. "hide_name": 0,
  54354. "type": "SB_LUT4",
  54355. "parameters": {
  54356. "LUT_INIT": "1111110000110000"
  54357. },
  54358. "attributes": {
  54359. "module_not_derived": "00000000000000000000000000000001",
  54360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54361. },
  54362. "port_directions": {
  54363. "I0": "input",
  54364. "I1": "input",
  54365. "I2": "input",
  54366. "I3": "input",
  54367. "O": "output"
  54368. },
  54369. "connections": {
  54370. "I0": [ "0" ],
  54371. "I1": [ 2344 ],
  54372. "I2": [ 2410 ],
  54373. "I3": [ 2416 ],
  54374. "O": [ 2417 ]
  54375. }
  54376. },
  54377. "cpu_I._zz_215__SB_LUT4_O_17": {
  54378. "hide_name": 0,
  54379. "type": "SB_LUT4",
  54380. "parameters": {
  54381. "LUT_INIT": "0000111100000011"
  54382. },
  54383. "attributes": {
  54384. "module_not_derived": "00000000000000000000000000000001",
  54385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54386. },
  54387. "port_directions": {
  54388. "I0": "input",
  54389. "I1": "input",
  54390. "I2": "input",
  54391. "I3": "input",
  54392. "O": "output"
  54393. },
  54394. "connections": {
  54395. "I0": [ "0" ],
  54396. "I1": [ 2344 ],
  54397. "I2": [ 2408 ],
  54398. "I3": [ 2353 ],
  54399. "O": [ 2418 ]
  54400. }
  54401. },
  54402. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O": {
  54403. "hide_name": 0,
  54404. "type": "SB_LUT4",
  54405. "parameters": {
  54406. "LUT_INIT": "1111001111000000"
  54407. },
  54408. "attributes": {
  54409. "module_not_derived": "00000000000000000000000000000001",
  54410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54411. },
  54412. "port_directions": {
  54413. "I0": "input",
  54414. "I1": "input",
  54415. "I2": "input",
  54416. "I3": "input",
  54417. "O": "output"
  54418. },
  54419. "connections": {
  54420. "I0": [ "0" ],
  54421. "I1": [ 2359 ],
  54422. "I2": [ 2419 ],
  54423. "I3": [ 2420 ],
  54424. "O": [ 2354 ]
  54425. }
  54426. },
  54427. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O_1": {
  54428. "hide_name": 0,
  54429. "type": "SB_LUT4",
  54430. "parameters": {
  54431. "LUT_INIT": "1111110000110000"
  54432. },
  54433. "attributes": {
  54434. "module_not_derived": "00000000000000000000000000000001",
  54435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54436. },
  54437. "port_directions": {
  54438. "I0": "input",
  54439. "I1": "input",
  54440. "I2": "input",
  54441. "I3": "input",
  54442. "O": "output"
  54443. },
  54444. "connections": {
  54445. "I0": [ "0" ],
  54446. "I1": [ 2359 ],
  54447. "I2": [ 2410 ],
  54448. "I3": [ 2421 ],
  54449. "O": [ 2353 ]
  54450. }
  54451. },
  54452. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O_1_I3_SB_LUT4_I2": {
  54453. "hide_name": 0,
  54454. "type": "SB_LUT4",
  54455. "parameters": {
  54456. "LUT_INIT": "1100111100000011"
  54457. },
  54458. "attributes": {
  54459. "module_not_derived": "00000000000000000000000000000001",
  54460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54461. },
  54462. "port_directions": {
  54463. "I0": "input",
  54464. "I1": "input",
  54465. "I2": "input",
  54466. "I3": "input",
  54467. "O": "output"
  54468. },
  54469. "connections": {
  54470. "I0": [ "0" ],
  54471. "I1": [ 2359 ],
  54472. "I2": [ 2421 ],
  54473. "I3": [ 2420 ],
  54474. "O": [ 2422 ]
  54475. }
  54476. },
  54477. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O": {
  54478. "hide_name": 0,
  54479. "type": "SB_LUT4",
  54480. "parameters": {
  54481. "LUT_INIT": "0000000000001111"
  54482. },
  54483. "attributes": {
  54484. "module_not_derived": "00000000000000000000000000000001",
  54485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  54486. },
  54487. "port_directions": {
  54488. "I0": "input",
  54489. "I1": "input",
  54490. "I2": "input",
  54491. "I3": "input",
  54492. "O": "output"
  54493. },
  54494. "connections": {
  54495. "I0": [ "0" ],
  54496. "I1": [ "0" ],
  54497. "I2": [ 2344 ],
  54498. "I3": [ 2410 ],
  54499. "O": [ 2408 ]
  54500. }
  54501. },
  54502. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O_1_I3_SB_LUT4_O": {
  54503. "hide_name": 0,
  54504. "type": "SB_LUT4",
  54505. "parameters": {
  54506. "LUT_INIT": "0000001111001111"
  54507. },
  54508. "attributes": {
  54509. "module_not_derived": "00000000000000000000000000000001",
  54510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54511. },
  54512. "port_directions": {
  54513. "I0": "input",
  54514. "I1": "input",
  54515. "I2": "input",
  54516. "I3": "input",
  54517. "O": "output"
  54518. },
  54519. "connections": {
  54520. "I0": [ "0" ],
  54521. "I1": [ 2362 ],
  54522. "I2": [ 2411 ],
  54523. "I3": [ 2423 ],
  54524. "O": [ 2421 ]
  54525. }
  54526. },
  54527. "cpu_I._zz_215__SB_LUT4_O_18": {
  54528. "hide_name": 0,
  54529. "type": "SB_LUT4",
  54530. "parameters": {
  54531. "LUT_INIT": "0000111100000011"
  54532. },
  54533. "attributes": {
  54534. "module_not_derived": "00000000000000000000000000000001",
  54535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54536. },
  54537. "port_directions": {
  54538. "I0": "input",
  54539. "I1": "input",
  54540. "I2": "input",
  54541. "I3": "input",
  54542. "O": "output"
  54543. },
  54544. "connections": {
  54545. "I0": [ "0" ],
  54546. "I1": [ 2344 ],
  54547. "I2": [ 2408 ],
  54548. "I3": [ 2424 ],
  54549. "O": [ 2425 ]
  54550. }
  54551. },
  54552. "cpu_I._zz_215__SB_LUT4_O_19": {
  54553. "hide_name": 0,
  54554. "type": "SB_LUT4",
  54555. "parameters": {
  54556. "LUT_INIT": "0000111100000011"
  54557. },
  54558. "attributes": {
  54559. "module_not_derived": "00000000000000000000000000000001",
  54560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54561. },
  54562. "port_directions": {
  54563. "I0": "input",
  54564. "I1": "input",
  54565. "I2": "input",
  54566. "I3": "input",
  54567. "O": "output"
  54568. },
  54569. "connections": {
  54570. "I0": [ "0" ],
  54571. "I1": [ 2344 ],
  54572. "I2": [ 2408 ],
  54573. "I3": [ 2426 ],
  54574. "O": [ 2427 ]
  54575. }
  54576. },
  54577. "cpu_I._zz_215__SB_LUT4_O_2": {
  54578. "hide_name": 0,
  54579. "type": "SB_LUT4",
  54580. "parameters": {
  54581. "LUT_INIT": "1010100011111101"
  54582. },
  54583. "attributes": {
  54584. "module_not_derived": "00000000000000000000000000000001",
  54585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  54586. },
  54587. "port_directions": {
  54588. "I0": "input",
  54589. "I1": "input",
  54590. "I2": "input",
  54591. "I3": "input",
  54592. "O": "output"
  54593. },
  54594. "connections": {
  54595. "I0": [ 2344 ],
  54596. "I1": [ 2428 ],
  54597. "I2": [ 2429 ],
  54598. "I3": [ 2422 ],
  54599. "O": [ 2430 ]
  54600. }
  54601. },
  54602. "cpu_I._zz_215__SB_LUT4_O_20": {
  54603. "hide_name": 0,
  54604. "type": "SB_LUT4",
  54605. "parameters": {
  54606. "LUT_INIT": "0000111100000011"
  54607. },
  54608. "attributes": {
  54609. "module_not_derived": "00000000000000000000000000000001",
  54610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54611. },
  54612. "port_directions": {
  54613. "I0": "input",
  54614. "I1": "input",
  54615. "I2": "input",
  54616. "I3": "input",
  54617. "O": "output"
  54618. },
  54619. "connections": {
  54620. "I0": [ "0" ],
  54621. "I1": [ 2344 ],
  54622. "I2": [ 2408 ],
  54623. "I3": [ 2431 ],
  54624. "O": [ 2432 ]
  54625. }
  54626. },
  54627. "cpu_I._zz_215__SB_LUT4_O_21": {
  54628. "hide_name": 0,
  54629. "type": "SB_LUT4",
  54630. "parameters": {
  54631. "LUT_INIT": "0000001100001111"
  54632. },
  54633. "attributes": {
  54634. "module_not_derived": "00000000000000000000000000000001",
  54635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54636. },
  54637. "port_directions": {
  54638. "I0": "input",
  54639. "I1": "input",
  54640. "I2": "input",
  54641. "I3": "input",
  54642. "O": "output"
  54643. },
  54644. "connections": {
  54645. "I0": [ "0" ],
  54646. "I1": [ 2344 ],
  54647. "I2": [ 2408 ],
  54648. "I3": [ 2433 ],
  54649. "O": [ 2434 ]
  54650. }
  54651. },
  54652. "cpu_I._zz_215__SB_LUT4_O_22": {
  54653. "hide_name": 0,
  54654. "type": "SB_LUT4",
  54655. "parameters": {
  54656. "LUT_INIT": "0000001100001111"
  54657. },
  54658. "attributes": {
  54659. "module_not_derived": "00000000000000000000000000000001",
  54660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54661. },
  54662. "port_directions": {
  54663. "I0": "input",
  54664. "I1": "input",
  54665. "I2": "input",
  54666. "I3": "input",
  54667. "O": "output"
  54668. },
  54669. "connections": {
  54670. "I0": [ "0" ],
  54671. "I1": [ 2344 ],
  54672. "I2": [ 2408 ],
  54673. "I3": [ 2435 ],
  54674. "O": [ 2436 ]
  54675. }
  54676. },
  54677. "cpu_I._zz_215__SB_LUT4_O_23": {
  54678. "hide_name": 0,
  54679. "type": "SB_LUT4",
  54680. "parameters": {
  54681. "LUT_INIT": "0000001100001111"
  54682. },
  54683. "attributes": {
  54684. "module_not_derived": "00000000000000000000000000000001",
  54685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54686. },
  54687. "port_directions": {
  54688. "I0": "input",
  54689. "I1": "input",
  54690. "I2": "input",
  54691. "I3": "input",
  54692. "O": "output"
  54693. },
  54694. "connections": {
  54695. "I0": [ "0" ],
  54696. "I1": [ 2344 ],
  54697. "I2": [ 2408 ],
  54698. "I3": [ 2437 ],
  54699. "O": [ 2438 ]
  54700. }
  54701. },
  54702. "cpu_I._zz_215__SB_LUT4_O_24": {
  54703. "hide_name": 0,
  54704. "type": "SB_LUT4",
  54705. "parameters": {
  54706. "LUT_INIT": "0000001100001111"
  54707. },
  54708. "attributes": {
  54709. "module_not_derived": "00000000000000000000000000000001",
  54710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54711. },
  54712. "port_directions": {
  54713. "I0": "input",
  54714. "I1": "input",
  54715. "I2": "input",
  54716. "I3": "input",
  54717. "O": "output"
  54718. },
  54719. "connections": {
  54720. "I0": [ "0" ],
  54721. "I1": [ 2344 ],
  54722. "I2": [ 2408 ],
  54723. "I3": [ 2439 ],
  54724. "O": [ 2440 ]
  54725. }
  54726. },
  54727. "cpu_I._zz_215__SB_LUT4_O_25": {
  54728. "hide_name": 0,
  54729. "type": "SB_LUT4",
  54730. "parameters": {
  54731. "LUT_INIT": "0000001001010111"
  54732. },
  54733. "attributes": {
  54734. "module_not_derived": "00000000000000000000000000000001",
  54735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  54736. },
  54737. "port_directions": {
  54738. "I0": "input",
  54739. "I1": "input",
  54740. "I2": "input",
  54741. "I3": "input",
  54742. "O": "output"
  54743. },
  54744. "connections": {
  54745. "I0": [ 2344 ],
  54746. "I1": [ 2441 ],
  54747. "I2": [ 2442 ],
  54748. "I3": [ 2443 ],
  54749. "O": [ 2444 ]
  54750. }
  54751. },
  54752. "cpu_I._zz_215__SB_LUT4_O_26": {
  54753. "hide_name": 0,
  54754. "type": "SB_LUT4",
  54755. "parameters": {
  54756. "LUT_INIT": "0000001100001111"
  54757. },
  54758. "attributes": {
  54759. "module_not_derived": "00000000000000000000000000000001",
  54760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54761. },
  54762. "port_directions": {
  54763. "I0": "input",
  54764. "I1": "input",
  54765. "I2": "input",
  54766. "I3": "input",
  54767. "O": "output"
  54768. },
  54769. "connections": {
  54770. "I0": [ "0" ],
  54771. "I1": [ 2344 ],
  54772. "I2": [ 2408 ],
  54773. "I3": [ 2422 ],
  54774. "O": [ 2445 ]
  54775. }
  54776. },
  54777. "cpu_I._zz_215__SB_LUT4_O_27": {
  54778. "hide_name": 0,
  54779. "type": "SB_LUT4",
  54780. "parameters": {
  54781. "LUT_INIT": "0000001100001111"
  54782. },
  54783. "attributes": {
  54784. "module_not_derived": "00000000000000000000000000000001",
  54785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54786. },
  54787. "port_directions": {
  54788. "I0": "input",
  54789. "I1": "input",
  54790. "I2": "input",
  54791. "I3": "input",
  54792. "O": "output"
  54793. },
  54794. "connections": {
  54795. "I0": [ "0" ],
  54796. "I1": [ 2344 ],
  54797. "I2": [ 2408 ],
  54798. "I3": [ 2351 ],
  54799. "O": [ 2446 ]
  54800. }
  54801. },
  54802. "cpu_I._zz_215__SB_LUT4_O_28": {
  54803. "hide_name": 0,
  54804. "type": "SB_LUT4",
  54805. "parameters": {
  54806. "LUT_INIT": "0000001100001111"
  54807. },
  54808. "attributes": {
  54809. "module_not_derived": "00000000000000000000000000000001",
  54810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54811. },
  54812. "port_directions": {
  54813. "I0": "input",
  54814. "I1": "input",
  54815. "I2": "input",
  54816. "I3": "input",
  54817. "O": "output"
  54818. },
  54819. "connections": {
  54820. "I0": [ "0" ],
  54821. "I1": [ 2344 ],
  54822. "I2": [ 2408 ],
  54823. "I3": [ 2443 ],
  54824. "O": [ 2447 ]
  54825. }
  54826. },
  54827. "cpu_I._zz_215__SB_LUT4_O_29": {
  54828. "hide_name": 0,
  54829. "type": "SB_LUT4",
  54830. "parameters": {
  54831. "LUT_INIT": "0000001100001111"
  54832. },
  54833. "attributes": {
  54834. "module_not_derived": "00000000000000000000000000000001",
  54835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54836. },
  54837. "port_directions": {
  54838. "I0": "input",
  54839. "I1": "input",
  54840. "I2": "input",
  54841. "I3": "input",
  54842. "O": "output"
  54843. },
  54844. "connections": {
  54845. "I0": [ "0" ],
  54846. "I1": [ 2344 ],
  54847. "I2": [ 2408 ],
  54848. "I3": [ 2347 ],
  54849. "O": [ 2448 ]
  54850. }
  54851. },
  54852. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O": {
  54853. "hide_name": 0,
  54854. "type": "SB_LUT4",
  54855. "parameters": {
  54856. "LUT_INIT": "0000100000101010"
  54857. },
  54858. "attributes": {
  54859. "module_not_derived": "00000000000000000000000000000001",
  54860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  54861. },
  54862. "port_directions": {
  54863. "I0": "input",
  54864. "I1": "input",
  54865. "I2": "input",
  54866. "I3": "input",
  54867. "O": "output"
  54868. },
  54869. "connections": {
  54870. "I0": [ 2359 ],
  54871. "I1": [ 2362 ],
  54872. "I2": [ 2449 ],
  54873. "I3": [ 2450 ],
  54874. "O": [ 2428 ]
  54875. }
  54876. },
  54877. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_1": {
  54878. "hide_name": 0,
  54879. "type": "SB_LUT4",
  54880. "parameters": {
  54881. "LUT_INIT": "0000000000001111"
  54882. },
  54883. "attributes": {
  54884. "module_not_derived": "00000000000000000000000000000001",
  54885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  54886. },
  54887. "port_directions": {
  54888. "I0": "input",
  54889. "I1": "input",
  54890. "I2": "input",
  54891. "I3": "input",
  54892. "O": "output"
  54893. },
  54894. "connections": {
  54895. "I0": [ "0" ],
  54896. "I1": [ "0" ],
  54897. "I2": [ 2359 ],
  54898. "I3": [ 2419 ],
  54899. "O": [ 2429 ]
  54900. }
  54901. },
  54902. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  54903. "hide_name": 0,
  54904. "type": "SB_LUT4",
  54905. "parameters": {
  54906. "LUT_INIT": "1111001111000000"
  54907. },
  54908. "attributes": {
  54909. "module_not_derived": "00000000000000000000000000000001",
  54910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54911. },
  54912. "port_directions": {
  54913. "I0": "input",
  54914. "I1": "input",
  54915. "I2": "input",
  54916. "I3": "input",
  54917. "O": "output"
  54918. },
  54919. "connections": {
  54920. "I0": [ "0" ],
  54921. "I1": [ 2362 ],
  54922. "I2": [ 2406 ],
  54923. "I3": [ 2407 ],
  54924. "O": [ 2420 ]
  54925. }
  54926. },
  54927. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_1_I3_SB_LUT4_O_1": {
  54928. "hide_name": 0,
  54929. "type": "SB_LUT4",
  54930. "parameters": {
  54931. "LUT_INIT": "1111110000110000"
  54932. },
  54933. "attributes": {
  54934. "module_not_derived": "00000000000000000000000000000001",
  54935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54936. },
  54937. "port_directions": {
  54938. "I0": "input",
  54939. "I1": "input",
  54940. "I2": "input",
  54941. "I3": "input",
  54942. "O": "output"
  54943. },
  54944. "connections": {
  54945. "I0": [ "0" ],
  54946. "I1": [ 2362 ],
  54947. "I2": [ 2405 ],
  54948. "I3": [ 2451 ],
  54949. "O": [ 2419 ]
  54950. }
  54951. },
  54952. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  54953. "hide_name": 0,
  54954. "type": "SB_LUT4",
  54955. "parameters": {
  54956. "LUT_INIT": "1111001111000000"
  54957. },
  54958. "attributes": {
  54959. "module_not_derived": "00000000000000000000000000000001",
  54960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54961. },
  54962. "port_directions": {
  54963. "I0": "input",
  54964. "I1": "input",
  54965. "I2": "input",
  54966. "I3": "input",
  54967. "O": "output"
  54968. },
  54969. "connections": {
  54970. "I0": [ "0" ],
  54971. "I1": [ 2367 ],
  54972. "I2": [ 2452 ],
  54973. "I3": [ 2453 ],
  54974. "O": [ 2449 ]
  54975. }
  54976. },
  54977. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1": {
  54978. "hide_name": 0,
  54979. "type": "SB_LUT4",
  54980. "parameters": {
  54981. "LUT_INIT": "1111001111000000"
  54982. },
  54983. "attributes": {
  54984. "module_not_derived": "00000000000000000000000000000001",
  54985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  54986. },
  54987. "port_directions": {
  54988. "I0": "input",
  54989. "I1": "input",
  54990. "I2": "input",
  54991. "I3": "input",
  54992. "O": "output"
  54993. },
  54994. "connections": {
  54995. "I0": [ "0" ],
  54996. "I1": [ 2367 ],
  54997. "I2": [ 2454 ],
  54998. "I3": [ 2455 ],
  54999. "O": [ 2450 ]
  55000. }
  55001. },
  55002. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  55003. "hide_name": 0,
  55004. "type": "SB_LUT4",
  55005. "parameters": {
  55006. "LUT_INIT": "1111110000110000"
  55007. },
  55008. "attributes": {
  55009. "module_not_derived": "00000000000000000000000000000001",
  55010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55011. },
  55012. "port_directions": {
  55013. "I0": "input",
  55014. "I1": "input",
  55015. "I2": "input",
  55016. "I3": "input",
  55017. "O": "output"
  55018. },
  55019. "connections": {
  55020. "I0": [ "0" ],
  55021. "I1": [ 2372 ],
  55022. "I2": [ 2456 ],
  55023. "I3": [ 2457 ],
  55024. "O": [ 2455 ]
  55025. }
  55026. },
  55027. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_I2": {
  55028. "hide_name": 0,
  55029. "type": "SB_LUT4",
  55030. "parameters": {
  55031. "LUT_INIT": "1111110000110000"
  55032. },
  55033. "attributes": {
  55034. "module_not_derived": "00000000000000000000000000000001",
  55035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55036. },
  55037. "port_directions": {
  55038. "I0": "input",
  55039. "I1": "input",
  55040. "I2": "input",
  55041. "I3": "input",
  55042. "O": "output"
  55043. },
  55044. "connections": {
  55045. "I0": [ "0" ],
  55046. "I1": [ 2372 ],
  55047. "I2": [ 2458 ],
  55048. "I3": [ 2456 ],
  55049. "O": [ 2459 ]
  55050. }
  55051. },
  55052. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  55053. "hide_name": 0,
  55054. "type": "SB_LUT4",
  55055. "parameters": {
  55056. "LUT_INIT": "0000110000111111"
  55057. },
  55058. "attributes": {
  55059. "module_not_derived": "00000000000000000000000000000001",
  55060. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55061. },
  55062. "port_directions": {
  55063. "I0": "input",
  55064. "I1": "input",
  55065. "I2": "input",
  55066. "I3": "input",
  55067. "O": "output"
  55068. },
  55069. "connections": {
  55070. "I0": [ "0" ],
  55071. "I1": [ 2378 ],
  55072. "I2": [ 2398 ],
  55073. "I3": [ 2399 ],
  55074. "O": [ 2458 ]
  55075. }
  55076. },
  55077. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55078. "hide_name": 0,
  55079. "type": "SB_LUT4",
  55080. "parameters": {
  55081. "LUT_INIT": "0000110000111111"
  55082. },
  55083. "attributes": {
  55084. "module_not_derived": "00000000000000000000000000000001",
  55085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55086. },
  55087. "port_directions": {
  55088. "I0": "input",
  55089. "I1": "input",
  55090. "I2": "input",
  55091. "I3": "input",
  55092. "O": "output"
  55093. },
  55094. "connections": {
  55095. "I0": [ "0" ],
  55096. "I1": [ 2378 ],
  55097. "I2": [ 2396 ],
  55098. "I3": [ 2397 ],
  55099. "O": [ 2456 ]
  55100. }
  55101. },
  55102. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_I2": {
  55103. "hide_name": 0,
  55104. "type": "SB_LUT4",
  55105. "parameters": {
  55106. "LUT_INIT": "1111110000110000"
  55107. },
  55108. "attributes": {
  55109. "module_not_derived": "00000000000000000000000000000001",
  55110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55111. },
  55112. "port_directions": {
  55113. "I0": "input",
  55114. "I1": "input",
  55115. "I2": "input",
  55116. "I3": "input",
  55117. "O": "output"
  55118. },
  55119. "connections": {
  55120. "I0": [ "0" ],
  55121. "I1": [ 2372 ],
  55122. "I2": [ 2457 ],
  55123. "I3": [ 2460 ],
  55124. "O": [ 2461 ]
  55125. }
  55126. },
  55127. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  55128. "hide_name": 0,
  55129. "type": "SB_LUT4",
  55130. "parameters": {
  55131. "LUT_INIT": "0000110000111111"
  55132. },
  55133. "attributes": {
  55134. "module_not_derived": "00000000000000000000000000000001",
  55135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55136. },
  55137. "port_directions": {
  55138. "I0": "input",
  55139. "I1": "input",
  55140. "I2": "input",
  55141. "I3": "input",
  55142. "O": "output"
  55143. },
  55144. "connections": {
  55145. "I0": [ "0" ],
  55146. "I1": [ 2378 ],
  55147. "I2": [ 2394 ],
  55148. "I3": [ 2395 ],
  55149. "O": [ 2457 ]
  55150. }
  55151. },
  55152. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  55153. "hide_name": 0,
  55154. "type": "SB_LUT4",
  55155. "parameters": {
  55156. "LUT_INIT": "0000110000111111"
  55157. },
  55158. "attributes": {
  55159. "module_not_derived": "00000000000000000000000000000001",
  55160. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55161. },
  55162. "port_directions": {
  55163. "I0": "input",
  55164. "I1": "input",
  55165. "I2": "input",
  55166. "I3": "input",
  55167. "O": "output"
  55168. },
  55169. "connections": {
  55170. "I0": [ "0" ],
  55171. "I1": [ 2378 ],
  55172. "I2": [ 2392 ],
  55173. "I3": [ 2393 ],
  55174. "O": [ 2460 ]
  55175. }
  55176. },
  55177. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  55178. "hide_name": 0,
  55179. "type": "SB_LUT4",
  55180. "parameters": {
  55181. "LUT_INIT": "0000110000111111"
  55182. },
  55183. "attributes": {
  55184. "module_not_derived": "00000000000000000000000000000001",
  55185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55186. },
  55187. "port_directions": {
  55188. "I0": "input",
  55189. "I1": "input",
  55190. "I2": "input",
  55191. "I3": "input",
  55192. "O": "output"
  55193. },
  55194. "connections": {
  55195. "I0": [ "0" ],
  55196. "I1": [ 2372 ],
  55197. "I2": [ 2462 ],
  55198. "I3": [ 2463 ],
  55199. "O": [ 2464 ]
  55200. }
  55201. },
  55202. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55203. "hide_name": 0,
  55204. "type": "SB_LUT4",
  55205. "parameters": {
  55206. "LUT_INIT": "1111001111000000"
  55207. },
  55208. "attributes": {
  55209. "module_not_derived": "00000000000000000000000000000001",
  55210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55211. },
  55212. "port_directions": {
  55213. "I0": "input",
  55214. "I1": "input",
  55215. "I2": "input",
  55216. "I3": "input",
  55217. "O": "output"
  55218. },
  55219. "connections": {
  55220. "I0": [ "0" ],
  55221. "I1": [ 2372 ],
  55222. "I2": [ 2465 ],
  55223. "I3": [ 2466 ],
  55224. "O": [ 2452 ]
  55225. }
  55226. },
  55227. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  55228. "hide_name": 0,
  55229. "type": "SB_LUT4",
  55230. "parameters": {
  55231. "LUT_INIT": "0000110000111111"
  55232. },
  55233. "attributes": {
  55234. "module_not_derived": "00000000000000000000000000000001",
  55235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55236. },
  55237. "port_directions": {
  55238. "I0": "input",
  55239. "I1": "input",
  55240. "I2": "input",
  55241. "I3": "input",
  55242. "O": "output"
  55243. },
  55244. "connections": {
  55245. "I0": [ "0" ],
  55246. "I1": [ 2378 ],
  55247. "I2": [ 1251 ],
  55248. "I3": [ 2467 ],
  55249. "O": [ 2468 ]
  55250. }
  55251. },
  55252. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55253. "hide_name": 0,
  55254. "type": "SB_LUT4",
  55255. "parameters": {
  55256. "LUT_INIT": "0000110000111111"
  55257. },
  55258. "attributes": {
  55259. "module_not_derived": "00000000000000000000000000000001",
  55260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55261. },
  55262. "port_directions": {
  55263. "I0": "input",
  55264. "I1": "input",
  55265. "I2": "input",
  55266. "I3": "input",
  55267. "O": "output"
  55268. },
  55269. "connections": {
  55270. "I0": [ "0" ],
  55271. "I1": [ 2378 ],
  55272. "I2": [ 2469 ],
  55273. "I3": [ 2470 ],
  55274. "O": [ 2462 ]
  55275. }
  55276. },
  55277. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  55278. "hide_name": 0,
  55279. "type": "SB_LUT4",
  55280. "parameters": {
  55281. "LUT_INIT": "0000110000111111"
  55282. },
  55283. "attributes": {
  55284. "module_not_derived": "00000000000000000000000000000001",
  55285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55286. },
  55287. "port_directions": {
  55288. "I0": "input",
  55289. "I1": "input",
  55290. "I2": "input",
  55291. "I3": "input",
  55292. "O": "output"
  55293. },
  55294. "connections": {
  55295. "I0": [ "0" ],
  55296. "I1": [ 2378 ],
  55297. "I2": [ 2471 ],
  55298. "I3": [ 2472 ],
  55299. "O": [ 2465 ]
  55300. }
  55301. },
  55302. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  55303. "hide_name": 0,
  55304. "type": "SB_LUT4",
  55305. "parameters": {
  55306. "LUT_INIT": "0000110000111111"
  55307. },
  55308. "attributes": {
  55309. "module_not_derived": "00000000000000000000000000000001",
  55310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55311. },
  55312. "port_directions": {
  55313. "I0": "input",
  55314. "I1": "input",
  55315. "I2": "input",
  55316. "I3": "input",
  55317. "O": "output"
  55318. },
  55319. "connections": {
  55320. "I0": [ "0" ],
  55321. "I1": [ 2378 ],
  55322. "I2": [ 2473 ],
  55323. "I3": [ 2474 ],
  55324. "O": [ 2463 ]
  55325. }
  55326. },
  55327. "cpu_I._zz_215__SB_LUT4_O_3": {
  55328. "hide_name": 0,
  55329. "type": "SB_LUT4",
  55330. "parameters": {
  55331. "LUT_INIT": "0000110000111111"
  55332. },
  55333. "attributes": {
  55334. "module_not_derived": "00000000000000000000000000000001",
  55335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55336. },
  55337. "port_directions": {
  55338. "I0": "input",
  55339. "I1": "input",
  55340. "I2": "input",
  55341. "I3": "input",
  55342. "O": "output"
  55343. },
  55344. "connections": {
  55345. "I0": [ "0" ],
  55346. "I1": [ 2344 ],
  55347. "I2": [ 2475 ],
  55348. "I3": [ 2439 ],
  55349. "O": [ 2476 ]
  55350. }
  55351. },
  55352. "cpu_I._zz_215__SB_LUT4_O_30": {
  55353. "hide_name": 0,
  55354. "type": "SB_LUT4",
  55355. "parameters": {
  55356. "LUT_INIT": "1111110000110000"
  55357. },
  55358. "attributes": {
  55359. "module_not_derived": "00000000000000000000000000000001",
  55360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55361. },
  55362. "port_directions": {
  55363. "I0": "input",
  55364. "I1": "input",
  55365. "I2": "input",
  55366. "I3": "input",
  55367. "O": "output"
  55368. },
  55369. "connections": {
  55370. "I0": [ "0" ],
  55371. "I1": [ 2344 ],
  55372. "I2": [ 2412 ],
  55373. "I3": [ 2477 ],
  55374. "O": [ 2478 ]
  55375. }
  55376. },
  55377. "cpu_I._zz_215__SB_LUT4_O_30_I2_SB_LUT4_O": {
  55378. "hide_name": 0,
  55379. "type": "SB_LUT4",
  55380. "parameters": {
  55381. "LUT_INIT": "0011000011111100"
  55382. },
  55383. "attributes": {
  55384. "module_not_derived": "00000000000000000000000000000001",
  55385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55386. },
  55387. "port_directions": {
  55388. "I0": "input",
  55389. "I1": "input",
  55390. "I2": "input",
  55391. "I3": "input",
  55392. "O": "output"
  55393. },
  55394. "connections": {
  55395. "I0": [ "0" ],
  55396. "I1": [ 2359 ],
  55397. "I2": [ 2410 ],
  55398. "I3": [ 2479 ],
  55399. "O": [ 2412 ]
  55400. }
  55401. },
  55402. "cpu_I._zz_215__SB_LUT4_O_30_I2_SB_LUT4_O_1": {
  55403. "hide_name": 0,
  55404. "type": "SB_LUT4",
  55405. "parameters": {
  55406. "LUT_INIT": "0000110000111111"
  55407. },
  55408. "attributes": {
  55409. "module_not_derived": "00000000000000000000000000000001",
  55410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55411. },
  55412. "port_directions": {
  55413. "I0": "input",
  55414. "I1": "input",
  55415. "I2": "input",
  55416. "I3": "input",
  55417. "O": "output"
  55418. },
  55419. "connections": {
  55420. "I0": [ "0" ],
  55421. "I1": [ 2359 ],
  55422. "I2": [ 2480 ],
  55423. "I3": [ 2481 ],
  55424. "O": [ 2477 ]
  55425. }
  55426. },
  55427. "cpu_I._zz_215__SB_LUT4_O_31": {
  55428. "hide_name": 0,
  55429. "type": "SB_LUT4",
  55430. "parameters": {
  55431. "LUT_INIT": "1111110000110000"
  55432. },
  55433. "attributes": {
  55434. "module_not_derived": "00000000000000000000000000000001",
  55435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55436. },
  55437. "port_directions": {
  55438. "I0": "input",
  55439. "I1": "input",
  55440. "I2": "input",
  55441. "I3": "input",
  55442. "O": "output"
  55443. },
  55444. "connections": {
  55445. "I0": [ "0" ],
  55446. "I1": [ 2344 ],
  55447. "I2": [ 2416 ],
  55448. "I3": [ 2482 ],
  55449. "O": [ 2483 ]
  55450. }
  55451. },
  55452. "cpu_I._zz_215__SB_LUT4_O_31_I2_SB_LUT4_O": {
  55453. "hide_name": 0,
  55454. "type": "SB_LUT4",
  55455. "parameters": {
  55456. "LUT_INIT": "0011000011111100"
  55457. },
  55458. "attributes": {
  55459. "module_not_derived": "00000000000000000000000000000001",
  55460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55461. },
  55462. "port_directions": {
  55463. "I0": "input",
  55464. "I1": "input",
  55465. "I2": "input",
  55466. "I3": "input",
  55467. "O": "output"
  55468. },
  55469. "connections": {
  55470. "I0": [ "0" ],
  55471. "I1": [ 2359 ],
  55472. "I2": [ 2410 ],
  55473. "I3": [ 2484 ],
  55474. "O": [ 2416 ]
  55475. }
  55476. },
  55477. "cpu_I._zz_215__SB_LUT4_O_31_I2_SB_LUT4_O_1": {
  55478. "hide_name": 0,
  55479. "type": "SB_LUT4",
  55480. "parameters": {
  55481. "LUT_INIT": "0000110000111111"
  55482. },
  55483. "attributes": {
  55484. "module_not_derived": "00000000000000000000000000000001",
  55485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55486. },
  55487. "port_directions": {
  55488. "I0": "input",
  55489. "I1": "input",
  55490. "I2": "input",
  55491. "I3": "input",
  55492. "O": "output"
  55493. },
  55494. "connections": {
  55495. "I0": [ "0" ],
  55496. "I1": [ 2359 ],
  55497. "I2": [ 2485 ],
  55498. "I3": [ 2486 ],
  55499. "O": [ 2482 ]
  55500. }
  55501. },
  55502. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O": {
  55503. "hide_name": 0,
  55504. "type": "SB_LUT4",
  55505. "parameters": {
  55506. "LUT_INIT": "1111110000110000"
  55507. },
  55508. "attributes": {
  55509. "module_not_derived": "00000000000000000000000000000001",
  55510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55511. },
  55512. "port_directions": {
  55513. "I0": "input",
  55514. "I1": "input",
  55515. "I2": "input",
  55516. "I3": "input",
  55517. "O": "output"
  55518. },
  55519. "connections": {
  55520. "I0": [ "0" ],
  55521. "I1": [ 2359 ],
  55522. "I2": [ 2485 ],
  55523. "I3": [ 2487 ],
  55524. "O": [ 2475 ]
  55525. }
  55526. },
  55527. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  55528. "hide_name": 0,
  55529. "type": "SB_LUT4",
  55530. "parameters": {
  55531. "LUT_INIT": "1111001111000000"
  55532. },
  55533. "attributes": {
  55534. "module_not_derived": "00000000000000000000000000000001",
  55535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55536. },
  55537. "port_directions": {
  55538. "I0": "input",
  55539. "I1": "input",
  55540. "I2": "input",
  55541. "I3": "input",
  55542. "O": "output"
  55543. },
  55544. "connections": {
  55545. "I0": [ "0" ],
  55546. "I1": [ 2362 ],
  55547. "I2": [ 2488 ],
  55548. "I3": [ 2489 ],
  55549. "O": [ 2487 ]
  55550. }
  55551. },
  55552. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55553. "hide_name": 0,
  55554. "type": "SB_LUT4",
  55555. "parameters": {
  55556. "LUT_INIT": "1111001111000000"
  55557. },
  55558. "attributes": {
  55559. "module_not_derived": "00000000000000000000000000000001",
  55560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55561. },
  55562. "port_directions": {
  55563. "I0": "input",
  55564. "I1": "input",
  55565. "I2": "input",
  55566. "I3": "input",
  55567. "O": "output"
  55568. },
  55569. "connections": {
  55570. "I0": [ "0" ],
  55571. "I1": [ 2362 ],
  55572. "I2": [ 2490 ],
  55573. "I3": [ 2491 ],
  55574. "O": [ 2485 ]
  55575. }
  55576. },
  55577. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  55578. "hide_name": 0,
  55579. "type": "SB_LUT4",
  55580. "parameters": {
  55581. "LUT_INIT": "1111110000110000"
  55582. },
  55583. "attributes": {
  55584. "module_not_derived": "00000000000000000000000000000001",
  55585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55586. },
  55587. "port_directions": {
  55588. "I0": "input",
  55589. "I1": "input",
  55590. "I2": "input",
  55591. "I3": "input",
  55592. "O": "output"
  55593. },
  55594. "connections": {
  55595. "I0": [ "0" ],
  55596. "I1": [ 2367 ],
  55597. "I2": [ 2492 ],
  55598. "I3": [ 2493 ],
  55599. "O": [ 2494 ]
  55600. }
  55601. },
  55602. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_1": {
  55603. "hide_name": 0,
  55604. "type": "SB_LUT4",
  55605. "parameters": {
  55606. "LUT_INIT": "1111110000110000"
  55607. },
  55608. "attributes": {
  55609. "module_not_derived": "00000000000000000000000000000001",
  55610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55611. },
  55612. "port_directions": {
  55613. "I0": "input",
  55614. "I1": "input",
  55615. "I2": "input",
  55616. "I3": "input",
  55617. "O": "output"
  55618. },
  55619. "connections": {
  55620. "I0": [ "0" ],
  55621. "I1": [ 2367 ],
  55622. "I2": [ 2495 ],
  55623. "I3": [ 2496 ],
  55624. "O": [ 2491 ]
  55625. }
  55626. },
  55627. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_1_I2_SB_LUT4_O": {
  55628. "hide_name": 0,
  55629. "type": "SB_LUT4",
  55630. "parameters": {
  55631. "LUT_INIT": "1111110000110000"
  55632. },
  55633. "attributes": {
  55634. "module_not_derived": "00000000000000000000000000000001",
  55635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55636. },
  55637. "port_directions": {
  55638. "I0": "input",
  55639. "I1": "input",
  55640. "I2": "input",
  55641. "I3": "input",
  55642. "O": "output"
  55643. },
  55644. "connections": {
  55645. "I0": [ "0" ],
  55646. "I1": [ 2372 ],
  55647. "I2": [ 2390 ],
  55648. "I3": [ 2497 ],
  55649. "O": [ 2495 ]
  55650. }
  55651. },
  55652. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  55653. "hide_name": 0,
  55654. "type": "SB_LUT4",
  55655. "parameters": {
  55656. "LUT_INIT": "1111110000110000"
  55657. },
  55658. "attributes": {
  55659. "module_not_derived": "00000000000000000000000000000001",
  55660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55661. },
  55662. "port_directions": {
  55663. "I0": "input",
  55664. "I1": "input",
  55665. "I2": "input",
  55666. "I3": "input",
  55667. "O": "output"
  55668. },
  55669. "connections": {
  55670. "I0": [ "0" ],
  55671. "I1": [ 2372 ],
  55672. "I2": [ 2498 ],
  55673. "I3": [ 2499 ],
  55674. "O": [ 2496 ]
  55675. }
  55676. },
  55677. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  55678. "hide_name": 0,
  55679. "type": "SB_LUT4",
  55680. "parameters": {
  55681. "LUT_INIT": "1111110000110000"
  55682. },
  55683. "attributes": {
  55684. "module_not_derived": "00000000000000000000000000000001",
  55685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55686. },
  55687. "port_directions": {
  55688. "I0": "input",
  55689. "I1": "input",
  55690. "I2": "input",
  55691. "I3": "input",
  55692. "O": "output"
  55693. },
  55694. "connections": {
  55695. "I0": [ "0" ],
  55696. "I1": [ 2372 ],
  55697. "I2": [ 2377 ],
  55698. "I3": [ 2388 ],
  55699. "O": [ 2492 ]
  55700. }
  55701. },
  55702. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55703. "hide_name": 0,
  55704. "type": "SB_LUT4",
  55705. "parameters": {
  55706. "LUT_INIT": "1111110000110000"
  55707. },
  55708. "attributes": {
  55709. "module_not_derived": "00000000000000000000000000000001",
  55710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55711. },
  55712. "port_directions": {
  55713. "I0": "input",
  55714. "I1": "input",
  55715. "I2": "input",
  55716. "I3": "input",
  55717. "O": "output"
  55718. },
  55719. "connections": {
  55720. "I0": [ "0" ],
  55721. "I1": [ 2372 ],
  55722. "I2": [ 2389 ],
  55723. "I3": [ 2391 ],
  55724. "O": [ 2493 ]
  55725. }
  55726. },
  55727. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  55728. "hide_name": 0,
  55729. "type": "SB_LUT4",
  55730. "parameters": {
  55731. "LUT_INIT": "1111110000110000"
  55732. },
  55733. "attributes": {
  55734. "module_not_derived": "00000000000000000000000000000001",
  55735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55736. },
  55737. "port_directions": {
  55738. "I0": "input",
  55739. "I1": "input",
  55740. "I2": "input",
  55741. "I3": "input",
  55742. "O": "output"
  55743. },
  55744. "connections": {
  55745. "I0": [ "0" ],
  55746. "I1": [ 2367 ],
  55747. "I2": [ 2500 ],
  55748. "I3": [ 2501 ],
  55749. "O": [ 2490 ]
  55750. }
  55751. },
  55752. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  55753. "hide_name": 0,
  55754. "type": "SB_LUT4",
  55755. "parameters": {
  55756. "LUT_INIT": "1111110000110000"
  55757. },
  55758. "attributes": {
  55759. "module_not_derived": "00000000000000000000000000000001",
  55760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55761. },
  55762. "port_directions": {
  55763. "I0": "input",
  55764. "I1": "input",
  55765. "I2": "input",
  55766. "I3": "input",
  55767. "O": "output"
  55768. },
  55769. "connections": {
  55770. "I0": [ "0" ],
  55771. "I1": [ 2367 ],
  55772. "I2": [ 2459 ],
  55773. "I3": [ 2461 ],
  55774. "O": [ 2489 ]
  55775. }
  55776. },
  55777. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  55778. "hide_name": 0,
  55779. "type": "SB_LUT4",
  55780. "parameters": {
  55781. "LUT_INIT": "1111110000110000"
  55782. },
  55783. "attributes": {
  55784. "module_not_derived": "00000000000000000000000000000001",
  55785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55786. },
  55787. "port_directions": {
  55788. "I0": "input",
  55789. "I1": "input",
  55790. "I2": "input",
  55791. "I3": "input",
  55792. "O": "output"
  55793. },
  55794. "connections": {
  55795. "I0": [ "0" ],
  55796. "I1": [ 2372 ],
  55797. "I2": [ 2502 ],
  55798. "I3": [ 2503 ],
  55799. "O": [ 2500 ]
  55800. }
  55801. },
  55802. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55803. "hide_name": 0,
  55804. "type": "SB_LUT4",
  55805. "parameters": {
  55806. "LUT_INIT": "1111110000110000"
  55807. },
  55808. "attributes": {
  55809. "module_not_derived": "00000000000000000000000000000001",
  55810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55811. },
  55812. "port_directions": {
  55813. "I0": "input",
  55814. "I1": "input",
  55815. "I2": "input",
  55816. "I3": "input",
  55817. "O": "output"
  55818. },
  55819. "connections": {
  55820. "I0": [ "0" ],
  55821. "I1": [ 2372 ],
  55822. "I2": [ 2504 ],
  55823. "I3": [ 2505 ],
  55824. "O": [ 2501 ]
  55825. }
  55826. },
  55827. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O": {
  55828. "hide_name": 0,
  55829. "type": "SB_LUT4",
  55830. "parameters": {
  55831. "LUT_INIT": "1111110000110000"
  55832. },
  55833. "attributes": {
  55834. "module_not_derived": "00000000000000000000000000000001",
  55835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55836. },
  55837. "port_directions": {
  55838. "I0": "input",
  55839. "I1": "input",
  55840. "I2": "input",
  55841. "I3": "input",
  55842. "O": "output"
  55843. },
  55844. "connections": {
  55845. "I0": [ "0" ],
  55846. "I1": [ 2359 ],
  55847. "I2": [ 2484 ],
  55848. "I3": [ 2486 ],
  55849. "O": [ 2439 ]
  55850. }
  55851. },
  55852. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  55853. "hide_name": 0,
  55854. "type": "SB_LUT4",
  55855. "parameters": {
  55856. "LUT_INIT": "1100111100000011"
  55857. },
  55858. "attributes": {
  55859. "module_not_derived": "00000000000000000000000000000001",
  55860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55861. },
  55862. "port_directions": {
  55863. "I0": "input",
  55864. "I1": "input",
  55865. "I2": "input",
  55866. "I3": "input",
  55867. "O": "output"
  55868. },
  55869. "connections": {
  55870. "I0": [ "0" ],
  55871. "I1": [ 2362 ],
  55872. "I2": [ 2410 ],
  55873. "I3": [ 2506 ],
  55874. "O": [ 2484 ]
  55875. }
  55876. },
  55877. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  55878. "hide_name": 0,
  55879. "type": "SB_LUT4",
  55880. "parameters": {
  55881. "LUT_INIT": "1111110000110000"
  55882. },
  55883. "attributes": {
  55884. "module_not_derived": "00000000000000000000000000000001",
  55885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55886. },
  55887. "port_directions": {
  55888. "I0": "input",
  55889. "I1": "input",
  55890. "I2": "input",
  55891. "I3": "input",
  55892. "O": "output"
  55893. },
  55894. "connections": {
  55895. "I0": [ "0" ],
  55896. "I1": [ 2362 ],
  55897. "I2": [ 2507 ],
  55898. "I3": [ 2494 ],
  55899. "O": [ 2486 ]
  55900. }
  55901. },
  55902. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  55903. "hide_name": 0,
  55904. "type": "SB_LUT4",
  55905. "parameters": {
  55906. "LUT_INIT": "1111110000110000"
  55907. },
  55908. "attributes": {
  55909. "module_not_derived": "00000000000000000000000000000001",
  55910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55911. },
  55912. "port_directions": {
  55913. "I0": "input",
  55914. "I1": "input",
  55915. "I2": "input",
  55916. "I3": "input",
  55917. "O": "output"
  55918. },
  55919. "connections": {
  55920. "I0": [ "0" ],
  55921. "I1": [ 2367 ],
  55922. "I2": [ 2508 ],
  55923. "I3": [ 2509 ],
  55924. "O": [ 2506 ]
  55925. }
  55926. },
  55927. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  55928. "hide_name": 0,
  55929. "type": "SB_LUT4",
  55930. "parameters": {
  55931. "LUT_INIT": "1111110000110000"
  55932. },
  55933. "attributes": {
  55934. "module_not_derived": "00000000000000000000000000000001",
  55935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  55936. },
  55937. "port_directions": {
  55938. "I0": "input",
  55939. "I1": "input",
  55940. "I2": "input",
  55941. "I3": "input",
  55942. "O": "output"
  55943. },
  55944. "connections": {
  55945. "I0": [ "0" ],
  55946. "I1": [ 2367 ],
  55947. "I2": [ 2510 ],
  55948. "I3": [ 2511 ],
  55949. "O": [ 2507 ]
  55950. }
  55951. },
  55952. "cpu_I._zz_215__SB_LUT4_O_4": {
  55953. "hide_name": 0,
  55954. "type": "SB_LUT4",
  55955. "parameters": {
  55956. "LUT_INIT": "1010100011111101"
  55957. },
  55958. "attributes": {
  55959. "module_not_derived": "00000000000000000000000000000001",
  55960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  55961. },
  55962. "port_directions": {
  55963. "I0": "input",
  55964. "I1": "input",
  55965. "I2": "input",
  55966. "I3": "input",
  55967. "O": "output"
  55968. },
  55969. "connections": {
  55970. "I0": [ 2344 ],
  55971. "I1": [ 2512 ],
  55972. "I2": [ 2513 ],
  55973. "I3": [ 2437 ],
  55974. "O": [ 2514 ]
  55975. }
  55976. },
  55977. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O": {
  55978. "hide_name": 0,
  55979. "type": "SB_LUT4",
  55980. "parameters": {
  55981. "LUT_INIT": "0000001010001010"
  55982. },
  55983. "attributes": {
  55984. "module_not_derived": "00000000000000000000000000000001",
  55985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  55986. },
  55987. "port_directions": {
  55988. "I0": "input",
  55989. "I1": "input",
  55990. "I2": "input",
  55991. "I3": "input",
  55992. "O": "output"
  55993. },
  55994. "connections": {
  55995. "I0": [ 2359 ],
  55996. "I1": [ 2362 ],
  55997. "I2": [ 2515 ],
  55998. "I3": [ 2516 ],
  55999. "O": [ 2512 ]
  56000. }
  56001. },
  56002. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_1": {
  56003. "hide_name": 0,
  56004. "type": "SB_LUT4",
  56005. "parameters": {
  56006. "LUT_INIT": "0000000000001111"
  56007. },
  56008. "attributes": {
  56009. "module_not_derived": "00000000000000000000000000000001",
  56010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  56011. },
  56012. "port_directions": {
  56013. "I0": "input",
  56014. "I1": "input",
  56015. "I2": "input",
  56016. "I3": "input",
  56017. "O": "output"
  56018. },
  56019. "connections": {
  56020. "I0": [ "0" ],
  56021. "I1": [ "0" ],
  56022. "I2": [ 2359 ],
  56023. "I3": [ 2360 ],
  56024. "O": [ 2513 ]
  56025. }
  56026. },
  56027. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_I2": {
  56028. "hide_name": 0,
  56029. "type": "SB_LUT4",
  56030. "parameters": {
  56031. "LUT_INIT": "1111110000110000"
  56032. },
  56033. "attributes": {
  56034. "module_not_derived": "00000000000000000000000000000001",
  56035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56036. },
  56037. "port_directions": {
  56038. "I0": "input",
  56039. "I1": "input",
  56040. "I2": "input",
  56041. "I3": "input",
  56042. "O": "output"
  56043. },
  56044. "connections": {
  56045. "I0": [ "0" ],
  56046. "I1": [ 2362 ],
  56047. "I2": [ 2363 ],
  56048. "I3": [ 2515 ],
  56049. "O": [ 2517 ]
  56050. }
  56051. },
  56052. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  56053. "hide_name": 0,
  56054. "type": "SB_LUT4",
  56055. "parameters": {
  56056. "LUT_INIT": "1111110000110000"
  56057. },
  56058. "attributes": {
  56059. "module_not_derived": "00000000000000000000000000000001",
  56060. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56061. },
  56062. "port_directions": {
  56063. "I0": "input",
  56064. "I1": "input",
  56065. "I2": "input",
  56066. "I3": "input",
  56067. "O": "output"
  56068. },
  56069. "connections": {
  56070. "I0": [ "0" ],
  56071. "I1": [ 2367 ],
  56072. "I2": [ 2518 ],
  56073. "I3": [ 2519 ],
  56074. "O": [ 2363 ]
  56075. }
  56076. },
  56077. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56078. "hide_name": 0,
  56079. "type": "SB_LUT4",
  56080. "parameters": {
  56081. "LUT_INIT": "1111110000110000"
  56082. },
  56083. "attributes": {
  56084. "module_not_derived": "00000000000000000000000000000001",
  56085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56086. },
  56087. "port_directions": {
  56088. "I0": "input",
  56089. "I1": "input",
  56090. "I2": "input",
  56091. "I3": "input",
  56092. "O": "output"
  56093. },
  56094. "connections": {
  56095. "I0": [ "0" ],
  56096. "I1": [ 2367 ],
  56097. "I2": [ 2520 ],
  56098. "I3": [ 2455 ],
  56099. "O": [ 2515 ]
  56100. }
  56101. },
  56102. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  56103. "hide_name": 0,
  56104. "type": "SB_LUT4",
  56105. "parameters": {
  56106. "LUT_INIT": "1111110000110000"
  56107. },
  56108. "attributes": {
  56109. "module_not_derived": "00000000000000000000000000000001",
  56110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56111. },
  56112. "port_directions": {
  56113. "I0": "input",
  56114. "I1": "input",
  56115. "I2": "input",
  56116. "I3": "input",
  56117. "O": "output"
  56118. },
  56119. "connections": {
  56120. "I0": [ "0" ],
  56121. "I1": [ 2372 ],
  56122. "I2": [ 2497 ],
  56123. "I3": [ 2498 ],
  56124. "O": [ 2370 ]
  56125. }
  56126. },
  56127. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56128. "hide_name": 0,
  56129. "type": "SB_LUT4",
  56130. "parameters": {
  56131. "LUT_INIT": "1111001111000000"
  56132. },
  56133. "attributes": {
  56134. "module_not_derived": "00000000000000000000000000000001",
  56135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56136. },
  56137. "port_directions": {
  56138. "I0": "input",
  56139. "I1": "input",
  56140. "I2": "input",
  56141. "I3": "input",
  56142. "O": "output"
  56143. },
  56144. "connections": {
  56145. "I0": [ "0" ],
  56146. "I1": [ 2372 ],
  56147. "I2": [ 2502 ],
  56148. "I3": [ 2499 ],
  56149. "O": [ 2518 ]
  56150. }
  56151. },
  56152. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  56153. "hide_name": 0,
  56154. "type": "SB_LUT4",
  56155. "parameters": {
  56156. "LUT_INIT": "0000001111001111"
  56157. },
  56158. "attributes": {
  56159. "module_not_derived": "00000000000000000000000000000001",
  56160. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56161. },
  56162. "port_directions": {
  56163. "I0": "input",
  56164. "I1": "input",
  56165. "I2": "input",
  56166. "I3": "input",
  56167. "O": "output"
  56168. },
  56169. "connections": {
  56170. "I0": [ "0" ],
  56171. "I1": [ 2378 ],
  56172. "I2": [ 2521 ],
  56173. "I3": [ 2522 ],
  56174. "O": [ 2390 ]
  56175. }
  56176. },
  56177. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56178. "hide_name": 0,
  56179. "type": "SB_LUT4",
  56180. "parameters": {
  56181. "LUT_INIT": "0000001111001111"
  56182. },
  56183. "attributes": {
  56184. "module_not_derived": "00000000000000000000000000000001",
  56185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56186. },
  56187. "port_directions": {
  56188. "I0": "input",
  56189. "I1": "input",
  56190. "I2": "input",
  56191. "I3": "input",
  56192. "O": "output"
  56193. },
  56194. "connections": {
  56195. "I0": [ "0" ],
  56196. "I1": [ 2378 ],
  56197. "I2": [ 2523 ],
  56198. "I3": [ 2524 ],
  56199. "O": [ 2497 ]
  56200. }
  56201. },
  56202. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  56203. "hide_name": 0,
  56204. "type": "SB_LUT4",
  56205. "parameters": {
  56206. "LUT_INIT": "0000001111001111"
  56207. },
  56208. "attributes": {
  56209. "module_not_derived": "00000000000000000000000000000001",
  56210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56211. },
  56212. "port_directions": {
  56213. "I0": "input",
  56214. "I1": "input",
  56215. "I2": "input",
  56216. "I3": "input",
  56217. "O": "output"
  56218. },
  56219. "connections": {
  56220. "I0": [ "0" ],
  56221. "I1": [ 2378 ],
  56222. "I2": [ 2525 ],
  56223. "I3": [ 2526 ],
  56224. "O": [ 2498 ]
  56225. }
  56226. },
  56227. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  56228. "hide_name": 0,
  56229. "type": "SB_LUT4",
  56230. "parameters": {
  56231. "LUT_INIT": "0000001111001111"
  56232. },
  56233. "attributes": {
  56234. "module_not_derived": "00000000000000000000000000000001",
  56235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56236. },
  56237. "port_directions": {
  56238. "I0": "input",
  56239. "I1": "input",
  56240. "I2": "input",
  56241. "I3": "input",
  56242. "O": "output"
  56243. },
  56244. "connections": {
  56245. "I0": [ "0" ],
  56246. "I1": [ 2378 ],
  56247. "I2": [ 2527 ],
  56248. "I3": [ 2528 ],
  56249. "O": [ 2499 ]
  56250. }
  56251. },
  56252. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  56253. "hide_name": 0,
  56254. "type": "SB_LUT4",
  56255. "parameters": {
  56256. "LUT_INIT": "1111110000110000"
  56257. },
  56258. "attributes": {
  56259. "module_not_derived": "00000000000000000000000000000001",
  56260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56261. },
  56262. "port_directions": {
  56263. "I0": "input",
  56264. "I1": "input",
  56265. "I2": "input",
  56266. "I3": "input",
  56267. "O": "output"
  56268. },
  56269. "connections": {
  56270. "I0": [ "0" ],
  56271. "I1": [ 2372 ],
  56272. "I2": [ 2503 ],
  56273. "I3": [ 2504 ],
  56274. "O": [ 2519 ]
  56275. }
  56276. },
  56277. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  56278. "hide_name": 0,
  56279. "type": "SB_LUT4",
  56280. "parameters": {
  56281. "LUT_INIT": "1111110000110000"
  56282. },
  56283. "attributes": {
  56284. "module_not_derived": "00000000000000000000000000000001",
  56285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56286. },
  56287. "port_directions": {
  56288. "I0": "input",
  56289. "I1": "input",
  56290. "I2": "input",
  56291. "I3": "input",
  56292. "O": "output"
  56293. },
  56294. "connections": {
  56295. "I0": [ "0" ],
  56296. "I1": [ 2372 ],
  56297. "I2": [ 2505 ],
  56298. "I3": [ 2458 ],
  56299. "O": [ 2520 ]
  56300. }
  56301. },
  56302. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  56303. "hide_name": 0,
  56304. "type": "SB_LUT4",
  56305. "parameters": {
  56306. "LUT_INIT": "0000110000111111"
  56307. },
  56308. "attributes": {
  56309. "module_not_derived": "00000000000000000000000000000001",
  56310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56311. },
  56312. "port_directions": {
  56313. "I0": "input",
  56314. "I1": "input",
  56315. "I2": "input",
  56316. "I3": "input",
  56317. "O": "output"
  56318. },
  56319. "connections": {
  56320. "I0": [ "0" ],
  56321. "I1": [ 2378 ],
  56322. "I2": [ 2527 ],
  56323. "I3": [ 2528 ],
  56324. "O": [ 2502 ]
  56325. }
  56326. },
  56327. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56328. "hide_name": 0,
  56329. "type": "SB_LUT4",
  56330. "parameters": {
  56331. "LUT_INIT": "0000110000111111"
  56332. },
  56333. "attributes": {
  56334. "module_not_derived": "00000000000000000000000000000001",
  56335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56336. },
  56337. "port_directions": {
  56338. "I0": "input",
  56339. "I1": "input",
  56340. "I2": "input",
  56341. "I3": "input",
  56342. "O": "output"
  56343. },
  56344. "connections": {
  56345. "I0": [ "0" ],
  56346. "I1": [ 2378 ],
  56347. "I2": [ 2525 ],
  56348. "I3": [ 2526 ],
  56349. "O": [ 2503 ]
  56350. }
  56351. },
  56352. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  56353. "hide_name": 0,
  56354. "type": "SB_LUT4",
  56355. "parameters": {
  56356. "LUT_INIT": "0000110000111111"
  56357. },
  56358. "attributes": {
  56359. "module_not_derived": "00000000000000000000000000000001",
  56360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56361. },
  56362. "port_directions": {
  56363. "I0": "input",
  56364. "I1": "input",
  56365. "I2": "input",
  56366. "I3": "input",
  56367. "O": "output"
  56368. },
  56369. "connections": {
  56370. "I0": [ "0" ],
  56371. "I1": [ 2378 ],
  56372. "I2": [ 2523 ],
  56373. "I3": [ 2524 ],
  56374. "O": [ 2504 ]
  56375. }
  56376. },
  56377. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  56378. "hide_name": 0,
  56379. "type": "SB_LUT4",
  56380. "parameters": {
  56381. "LUT_INIT": "0000110000111111"
  56382. },
  56383. "attributes": {
  56384. "module_not_derived": "00000000000000000000000000000001",
  56385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56386. },
  56387. "port_directions": {
  56388. "I0": "input",
  56389. "I1": "input",
  56390. "I2": "input",
  56391. "I3": "input",
  56392. "O": "output"
  56393. },
  56394. "connections": {
  56395. "I0": [ "0" ],
  56396. "I1": [ 2378 ],
  56397. "I2": [ 2521 ],
  56398. "I3": [ 2522 ],
  56399. "O": [ 2505 ]
  56400. }
  56401. },
  56402. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  56403. "hide_name": 0,
  56404. "type": "SB_LUT4",
  56405. "parameters": {
  56406. "LUT_INIT": "1111110000110000"
  56407. },
  56408. "attributes": {
  56409. "module_not_derived": "00000000000000000000000000000001",
  56410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56411. },
  56412. "port_directions": {
  56413. "I0": "input",
  56414. "I1": "input",
  56415. "I2": "input",
  56416. "I3": "input",
  56417. "O": "output"
  56418. },
  56419. "connections": {
  56420. "I0": [ "0" ],
  56421. "I1": [ 2367 ],
  56422. "I2": [ 2454 ],
  56423. "I3": [ 2453 ],
  56424. "O": [ 2516 ]
  56425. }
  56426. },
  56427. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_1": {
  56428. "hide_name": 0,
  56429. "type": "SB_LUT4",
  56430. "parameters": {
  56431. "LUT_INIT": "1100000011110011"
  56432. },
  56433. "attributes": {
  56434. "module_not_derived": "00000000000000000000000000000001",
  56435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56436. },
  56437. "port_directions": {
  56438. "I0": "input",
  56439. "I1": "input",
  56440. "I2": "input",
  56441. "I3": "input",
  56442. "O": "output"
  56443. },
  56444. "connections": {
  56445. "I0": [ "0" ],
  56446. "I1": [ 2367 ],
  56447. "I2": [ 2464 ],
  56448. "I3": [ 2452 ],
  56449. "O": [ 2529 ]
  56450. }
  56451. },
  56452. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  56453. "hide_name": 0,
  56454. "type": "SB_LUT4",
  56455. "parameters": {
  56456. "LUT_INIT": "1111001111000000"
  56457. },
  56458. "attributes": {
  56459. "module_not_derived": "00000000000000000000000000000001",
  56460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56461. },
  56462. "port_directions": {
  56463. "I0": "input",
  56464. "I1": "input",
  56465. "I2": "input",
  56466. "I3": "input",
  56467. "O": "output"
  56468. },
  56469. "connections": {
  56470. "I0": [ "0" ],
  56471. "I1": [ 2372 ],
  56472. "I2": [ 2530 ],
  56473. "I3": [ 2460 ],
  56474. "O": [ 2454 ]
  56475. }
  56476. },
  56477. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56478. "hide_name": 0,
  56479. "type": "SB_LUT4",
  56480. "parameters": {
  56481. "LUT_INIT": "1111110000110000"
  56482. },
  56483. "attributes": {
  56484. "module_not_derived": "00000000000000000000000000000001",
  56485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56486. },
  56487. "port_directions": {
  56488. "I0": "input",
  56489. "I1": "input",
  56490. "I2": "input",
  56491. "I3": "input",
  56492. "O": "output"
  56493. },
  56494. "connections": {
  56495. "I0": [ "0" ],
  56496. "I1": [ 2372 ],
  56497. "I2": [ 2531 ],
  56498. "I3": [ 2532 ],
  56499. "O": [ 2453 ]
  56500. }
  56501. },
  56502. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2": {
  56503. "hide_name": 0,
  56504. "type": "SB_LUT4",
  56505. "parameters": {
  56506. "LUT_INIT": "1111110000110000"
  56507. },
  56508. "attributes": {
  56509. "module_not_derived": "00000000000000000000000000000001",
  56510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56511. },
  56512. "port_directions": {
  56513. "I0": "input",
  56514. "I1": "input",
  56515. "I2": "input",
  56516. "I3": "input",
  56517. "O": "output"
  56518. },
  56519. "connections": {
  56520. "I0": [ "0" ],
  56521. "I1": [ 2372 ],
  56522. "I2": [ 2530 ],
  56523. "I3": [ 2531 ],
  56524. "O": [ 2533 ]
  56525. }
  56526. },
  56527. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O": {
  56528. "hide_name": 0,
  56529. "type": "SB_LUT4",
  56530. "parameters": {
  56531. "LUT_INIT": "1111001111000000"
  56532. },
  56533. "attributes": {
  56534. "module_not_derived": "00000000000000000000000000000001",
  56535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56536. },
  56537. "port_directions": {
  56538. "I0": "input",
  56539. "I1": "input",
  56540. "I2": "input",
  56541. "I3": "input",
  56542. "O": "output"
  56543. },
  56544. "connections": {
  56545. "I0": [ "0" ],
  56546. "I1": [ 2372 ],
  56547. "I2": [ 2466 ],
  56548. "I3": [ 2532 ],
  56549. "O": [ 2534 ]
  56550. }
  56551. },
  56552. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O_1": {
  56553. "hide_name": 0,
  56554. "type": "SB_LUT4",
  56555. "parameters": {
  56556. "LUT_INIT": "0011111100000000"
  56557. },
  56558. "attributes": {
  56559. "module_not_derived": "00000000000000000000000000000001",
  56560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56561. },
  56562. "port_directions": {
  56563. "I0": "input",
  56564. "I1": "input",
  56565. "I2": "input",
  56566. "I3": "input",
  56567. "O": "output"
  56568. },
  56569. "connections": {
  56570. "I0": [ "0" ],
  56571. "I1": [ 2535 ],
  56572. "I2": [ 2536 ],
  56573. "I3": [ 2537 ],
  56574. "O": [ 2367 ]
  56575. }
  56576. },
  56577. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  56578. "hide_name": 0,
  56579. "type": "SB_LUT4",
  56580. "parameters": {
  56581. "LUT_INIT": "0000110000111111"
  56582. },
  56583. "attributes": {
  56584. "module_not_derived": "00000000000000000000000000000001",
  56585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56586. },
  56587. "port_directions": {
  56588. "I0": "input",
  56589. "I1": "input",
  56590. "I2": "input",
  56591. "I3": "input",
  56592. "O": "output"
  56593. },
  56594. "connections": {
  56595. "I0": [ "0" ],
  56596. "I1": [ 2378 ],
  56597. "I2": [ 2386 ],
  56598. "I3": [ 2387 ],
  56599. "O": [ 2530 ]
  56600. }
  56601. },
  56602. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56603. "hide_name": 0,
  56604. "type": "SB_LUT4",
  56605. "parameters": {
  56606. "LUT_INIT": "0000110000111111"
  56607. },
  56608. "attributes": {
  56609. "module_not_derived": "00000000000000000000000000000001",
  56610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56611. },
  56612. "port_directions": {
  56613. "I0": "input",
  56614. "I1": "input",
  56615. "I2": "input",
  56616. "I3": "input",
  56617. "O": "output"
  56618. },
  56619. "connections": {
  56620. "I0": [ "0" ],
  56621. "I1": [ 2378 ],
  56622. "I2": [ 2384 ],
  56623. "I3": [ 2385 ],
  56624. "O": [ 2531 ]
  56625. }
  56626. },
  56627. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O": {
  56628. "hide_name": 0,
  56629. "type": "SB_LUT4",
  56630. "parameters": {
  56631. "LUT_INIT": "1111110000110000"
  56632. },
  56633. "attributes": {
  56634. "module_not_derived": "00000000000000000000000000000001",
  56635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56636. },
  56637. "port_directions": {
  56638. "I0": "input",
  56639. "I1": "input",
  56640. "I2": "input",
  56641. "I3": "input",
  56642. "O": "output"
  56643. },
  56644. "connections": {
  56645. "I0": [ "0" ],
  56646. "I1": [ 2359 ],
  56647. "I2": [ 2415 ],
  56648. "I3": [ 2361 ],
  56649. "O": [ 2437 ]
  56650. }
  56651. },
  56652. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  56653. "hide_name": 0,
  56654. "type": "SB_LUT4",
  56655. "parameters": {
  56656. "LUT_INIT": "0000001111001111"
  56657. },
  56658. "attributes": {
  56659. "module_not_derived": "00000000000000000000000000000001",
  56660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56661. },
  56662. "port_directions": {
  56663. "I0": "input",
  56664. "I1": "input",
  56665. "I2": "input",
  56666. "I3": "input",
  56667. "O": "output"
  56668. },
  56669. "connections": {
  56670. "I0": [ "0" ],
  56671. "I1": [ 2362 ],
  56672. "I2": [ 2410 ],
  56673. "I3": [ 2538 ],
  56674. "O": [ 2415 ]
  56675. }
  56676. },
  56677. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56678. "hide_name": 0,
  56679. "type": "SB_LUT4",
  56680. "parameters": {
  56681. "LUT_INIT": "1111110000110000"
  56682. },
  56683. "attributes": {
  56684. "module_not_derived": "00000000000000000000000000000001",
  56685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56686. },
  56687. "port_directions": {
  56688. "I0": "input",
  56689. "I1": "input",
  56690. "I2": "input",
  56691. "I3": "input",
  56692. "O": "output"
  56693. },
  56694. "connections": {
  56695. "I0": [ "0" ],
  56696. "I1": [ 2362 ],
  56697. "I2": [ 2539 ],
  56698. "I3": [ 2365 ],
  56699. "O": [ 2361 ]
  56700. }
  56701. },
  56702. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  56703. "hide_name": 0,
  56704. "type": "SB_LUT4",
  56705. "parameters": {
  56706. "LUT_INIT": "0101010011111110"
  56707. },
  56708. "attributes": {
  56709. "module_not_derived": "00000000000000000000000000000001",
  56710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  56711. },
  56712. "port_directions": {
  56713. "I0": "input",
  56714. "I1": "input",
  56715. "I2": "input",
  56716. "I3": "input",
  56717. "O": "output"
  56718. },
  56719. "connections": {
  56720. "I0": [ 2367 ],
  56721. "I1": [ 2410 ],
  56722. "I2": [ 2540 ],
  56723. "I3": [ 2541 ],
  56724. "O": [ 2538 ]
  56725. }
  56726. },
  56727. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  56728. "hide_name": 0,
  56729. "type": "SB_LUT4",
  56730. "parameters": {
  56731. "LUT_INIT": "1111110000110000"
  56732. },
  56733. "attributes": {
  56734. "module_not_derived": "00000000000000000000000000000001",
  56735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56736. },
  56737. "port_directions": {
  56738. "I0": "input",
  56739. "I1": "input",
  56740. "I2": "input",
  56741. "I3": "input",
  56742. "O": "output"
  56743. },
  56744. "connections": {
  56745. "I0": [ "0" ],
  56746. "I1": [ 2367 ],
  56747. "I2": [ 2542 ],
  56748. "I3": [ 2375 ],
  56749. "O": [ 2539 ]
  56750. }
  56751. },
  56752. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_I3": {
  56753. "hide_name": 0,
  56754. "type": "SB_LUT4",
  56755. "parameters": {
  56756. "LUT_INIT": "0000001100001111"
  56757. },
  56758. "attributes": {
  56759. "module_not_derived": "00000000000000000000000000000001",
  56760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56761. },
  56762. "port_directions": {
  56763. "I0": "input",
  56764. "I1": "input",
  56765. "I2": "input",
  56766. "I3": "input",
  56767. "O": "output"
  56768. },
  56769. "connections": {
  56770. "I0": [ "0" ],
  56771. "I1": [ 2367 ],
  56772. "I2": [ 2410 ],
  56773. "I3": [ 2540 ],
  56774. "O": [ 2411 ]
  56775. }
  56776. },
  56777. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O": {
  56778. "hide_name": 0,
  56779. "type": "SB_LUT4",
  56780. "parameters": {
  56781. "LUT_INIT": "1111110000110000"
  56782. },
  56783. "attributes": {
  56784. "module_not_derived": "00000000000000000000000000000001",
  56785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56786. },
  56787. "port_directions": {
  56788. "I0": "input",
  56789. "I1": "input",
  56790. "I2": "input",
  56791. "I3": "input",
  56792. "O": "output"
  56793. },
  56794. "connections": {
  56795. "I0": [ "0" ],
  56796. "I1": [ 2367 ],
  56797. "I2": [ 2541 ],
  56798. "I3": [ 2542 ],
  56799. "O": [ 2423 ]
  56800. }
  56801. },
  56802. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  56803. "hide_name": 0,
  56804. "type": "SB_LUT4",
  56805. "parameters": {
  56806. "LUT_INIT": "0000000011110000"
  56807. },
  56808. "attributes": {
  56809. "module_not_derived": "00000000000000000000000000000001",
  56810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  56811. },
  56812. "port_directions": {
  56813. "I0": "input",
  56814. "I1": "input",
  56815. "I2": "input",
  56816. "I3": "input",
  56817. "O": "output"
  56818. },
  56819. "connections": {
  56820. "I0": [ "0" ],
  56821. "I1": [ "0" ],
  56822. "I2": [ 2372 ],
  56823. "I3": [ 2543 ],
  56824. "O": [ 2540 ]
  56825. }
  56826. },
  56827. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  56828. "hide_name": 0,
  56829. "type": "SB_LUT4",
  56830. "parameters": {
  56831. "LUT_INIT": "1111110000110000"
  56832. },
  56833. "attributes": {
  56834. "module_not_derived": "00000000000000000000000000000001",
  56835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56836. },
  56837. "port_directions": {
  56838. "I0": "input",
  56839. "I1": "input",
  56840. "I2": "input",
  56841. "I3": "input",
  56842. "O": "output"
  56843. },
  56844. "connections": {
  56845. "I0": [ "0" ],
  56846. "I1": [ 2372 ],
  56847. "I2": [ 2544 ],
  56848. "I3": [ 2545 ],
  56849. "O": [ 2541 ]
  56850. }
  56851. },
  56852. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  56853. "hide_name": 0,
  56854. "type": "SB_LUT4",
  56855. "parameters": {
  56856. "LUT_INIT": "1111110000110000"
  56857. },
  56858. "attributes": {
  56859. "module_not_derived": "00000000000000000000000000000001",
  56860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56861. },
  56862. "port_directions": {
  56863. "I0": "input",
  56864. "I1": "input",
  56865. "I2": "input",
  56866. "I3": "input",
  56867. "O": "output"
  56868. },
  56869. "connections": {
  56870. "I0": [ "0" ],
  56871. "I1": [ 2372 ],
  56872. "I2": [ 2546 ],
  56873. "I3": [ 2381 ],
  56874. "O": [ 2542 ]
  56875. }
  56876. },
  56877. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  56878. "hide_name": 0,
  56879. "type": "SB_LUT4",
  56880. "parameters": {
  56881. "LUT_INIT": "0000001111001111"
  56882. },
  56883. "attributes": {
  56884. "module_not_derived": "00000000000000000000000000000001",
  56885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56886. },
  56887. "port_directions": {
  56888. "I0": "input",
  56889. "I1": "input",
  56890. "I2": "input",
  56891. "I3": "input",
  56892. "O": "output"
  56893. },
  56894. "connections": {
  56895. "I0": [ "0" ],
  56896. "I1": [ 2378 ],
  56897. "I2": [ 1251 ],
  56898. "I3": [ 2467 ],
  56899. "O": [ 2543 ]
  56900. }
  56901. },
  56902. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  56903. "hide_name": 0,
  56904. "type": "SB_LUT4",
  56905. "parameters": {
  56906. "LUT_INIT": "0000001111001111"
  56907. },
  56908. "attributes": {
  56909. "module_not_derived": "00000000000000000000000000000001",
  56910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56911. },
  56912. "port_directions": {
  56913. "I0": "input",
  56914. "I1": "input",
  56915. "I2": "input",
  56916. "I3": "input",
  56917. "O": "output"
  56918. },
  56919. "connections": {
  56920. "I0": [ "0" ],
  56921. "I1": [ 2378 ],
  56922. "I2": [ 2469 ],
  56923. "I3": [ 2470 ],
  56924. "O": [ 2544 ]
  56925. }
  56926. },
  56927. "cpu_I._zz_215__SB_LUT4_O_5": {
  56928. "hide_name": 0,
  56929. "type": "SB_LUT4",
  56930. "parameters": {
  56931. "LUT_INIT": "0000110000111111"
  56932. },
  56933. "attributes": {
  56934. "module_not_derived": "00000000000000000000000000000001",
  56935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56936. },
  56937. "port_directions": {
  56938. "I0": "input",
  56939. "I1": "input",
  56940. "I2": "input",
  56941. "I3": "input",
  56942. "O": "output"
  56943. },
  56944. "connections": {
  56945. "I0": [ "0" ],
  56946. "I1": [ 2344 ],
  56947. "I2": [ 2547 ],
  56948. "I3": [ 2435 ],
  56949. "O": [ 2548 ]
  56950. }
  56951. },
  56952. "cpu_I._zz_215__SB_LUT4_O_5_I2_SB_LUT4_O": {
  56953. "hide_name": 0,
  56954. "type": "SB_LUT4",
  56955. "parameters": {
  56956. "LUT_INIT": "1111110000110000"
  56957. },
  56958. "attributes": {
  56959. "module_not_derived": "00000000000000000000000000000001",
  56960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56961. },
  56962. "port_directions": {
  56963. "I0": "input",
  56964. "I1": "input",
  56965. "I2": "input",
  56966. "I3": "input",
  56967. "O": "output"
  56968. },
  56969. "connections": {
  56970. "I0": [ "0" ],
  56971. "I1": [ 2359 ],
  56972. "I2": [ 2480 ],
  56973. "I3": [ 2549 ],
  56974. "O": [ 2547 ]
  56975. }
  56976. },
  56977. "cpu_I._zz_215__SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  56978. "hide_name": 0,
  56979. "type": "SB_LUT4",
  56980. "parameters": {
  56981. "LUT_INIT": "1111110000110000"
  56982. },
  56983. "attributes": {
  56984. "module_not_derived": "00000000000000000000000000000001",
  56985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  56986. },
  56987. "port_directions": {
  56988. "I0": "input",
  56989. "I1": "input",
  56990. "I2": "input",
  56991. "I3": "input",
  56992. "O": "output"
  56993. },
  56994. "connections": {
  56995. "I0": [ "0" ],
  56996. "I1": [ 2359 ],
  56997. "I2": [ 2479 ],
  56998. "I3": [ 2481 ],
  56999. "O": [ 2435 ]
  57000. }
  57001. },
  57002. "cpu_I._zz_215__SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  57003. "hide_name": 0,
  57004. "type": "SB_LUT4",
  57005. "parameters": {
  57006. "LUT_INIT": "1111110000110000"
  57007. },
  57008. "attributes": {
  57009. "module_not_derived": "00000000000000000000000000000001",
  57010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57011. },
  57012. "port_directions": {
  57013. "I0": "input",
  57014. "I1": "input",
  57015. "I2": "input",
  57016. "I3": "input",
  57017. "O": "output"
  57018. },
  57019. "connections": {
  57020. "I0": [ "0" ],
  57021. "I1": [ 2362 ],
  57022. "I2": [ 2550 ],
  57023. "I3": [ 2551 ],
  57024. "O": [ 2549 ]
  57025. }
  57026. },
  57027. "cpu_I._zz_215__SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  57028. "hide_name": 0,
  57029. "type": "SB_LUT4",
  57030. "parameters": {
  57031. "LUT_INIT": "1111001111000000"
  57032. },
  57033. "attributes": {
  57034. "module_not_derived": "00000000000000000000000000000001",
  57035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57036. },
  57037. "port_directions": {
  57038. "I0": "input",
  57039. "I1": "input",
  57040. "I2": "input",
  57041. "I3": "input",
  57042. "O": "output"
  57043. },
  57044. "connections": {
  57045. "I0": [ "0" ],
  57046. "I1": [ 2362 ],
  57047. "I2": [ 2552 ],
  57048. "I3": [ 2553 ],
  57049. "O": [ 2480 ]
  57050. }
  57051. },
  57052. "cpu_I._zz_215__SB_LUT4_O_6": {
  57053. "hide_name": 0,
  57054. "type": "SB_LUT4",
  57055. "parameters": {
  57056. "LUT_INIT": "1010100011111101"
  57057. },
  57058. "attributes": {
  57059. "module_not_derived": "00000000000000000000000000000001",
  57060. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  57061. },
  57062. "port_directions": {
  57063. "I0": "input",
  57064. "I1": "input",
  57065. "I2": "input",
  57066. "I3": "input",
  57067. "O": "output"
  57068. },
  57069. "connections": {
  57070. "I0": [ 2344 ],
  57071. "I1": [ 2554 ],
  57072. "I2": [ 2555 ],
  57073. "I3": [ 2433 ],
  57074. "O": [ 2556 ]
  57075. }
  57076. },
  57077. "cpu_I._zz_215__SB_LUT4_O_6_I1_SB_LUT4_O": {
  57078. "hide_name": 0,
  57079. "type": "SB_LUT4",
  57080. "parameters": {
  57081. "LUT_INIT": "0000001010001010"
  57082. },
  57083. "attributes": {
  57084. "module_not_derived": "00000000000000000000000000000001",
  57085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  57086. },
  57087. "port_directions": {
  57088. "I0": "input",
  57089. "I1": "input",
  57090. "I2": "input",
  57091. "I3": "input",
  57092. "O": "output"
  57093. },
  57094. "connections": {
  57095. "I0": [ 2359 ],
  57096. "I1": [ 2362 ],
  57097. "I2": [ 2451 ],
  57098. "I3": [ 2450 ],
  57099. "O": [ 2554 ]
  57100. }
  57101. },
  57102. "cpu_I._zz_215__SB_LUT4_O_6_I1_SB_LUT4_O_1": {
  57103. "hide_name": 0,
  57104. "type": "SB_LUT4",
  57105. "parameters": {
  57106. "LUT_INIT": "0000000000001111"
  57107. },
  57108. "attributes": {
  57109. "module_not_derived": "00000000000000000000000000000001",
  57110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  57111. },
  57112. "port_directions": {
  57113. "I0": "input",
  57114. "I1": "input",
  57115. "I2": "input",
  57116. "I3": "input",
  57117. "O": "output"
  57118. },
  57119. "connections": {
  57120. "I0": [ "0" ],
  57121. "I1": [ "0" ],
  57122. "I2": [ 2359 ],
  57123. "I3": [ 2403 ],
  57124. "O": [ 2555 ]
  57125. }
  57126. },
  57127. "cpu_I._zz_215__SB_LUT4_O_6_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  57128. "hide_name": 0,
  57129. "type": "SB_LUT4",
  57130. "parameters": {
  57131. "LUT_INIT": "1111110000110000"
  57132. },
  57133. "attributes": {
  57134. "module_not_derived": "00000000000000000000000000000001",
  57135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57136. },
  57137. "port_directions": {
  57138. "I0": "input",
  57139. "I1": "input",
  57140. "I2": "input",
  57141. "I3": "input",
  57142. "O": "output"
  57143. },
  57144. "connections": {
  57145. "I0": [ "0" ],
  57146. "I1": [ 2367 ],
  57147. "I2": [ 2370 ],
  57148. "I3": [ 2518 ],
  57149. "O": [ 2405 ]
  57150. }
  57151. },
  57152. "cpu_I._zz_215__SB_LUT4_O_6_I1_SB_LUT4_O_I2_SB_LUT4_O_1": {
  57153. "hide_name": 0,
  57154. "type": "SB_LUT4",
  57155. "parameters": {
  57156. "LUT_INIT": "1111110000110000"
  57157. },
  57158. "attributes": {
  57159. "module_not_derived": "00000000000000000000000000000001",
  57160. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57161. },
  57162. "port_directions": {
  57163. "I0": "input",
  57164. "I1": "input",
  57165. "I2": "input",
  57166. "I3": "input",
  57167. "O": "output"
  57168. },
  57169. "connections": {
  57170. "I0": [ "0" ],
  57171. "I1": [ 2367 ],
  57172. "I2": [ 2519 ],
  57173. "I3": [ 2520 ],
  57174. "O": [ 2451 ]
  57175. }
  57176. },
  57177. "cpu_I._zz_215__SB_LUT4_O_6_I3_SB_LUT4_O": {
  57178. "hide_name": 0,
  57179. "type": "SB_LUT4",
  57180. "parameters": {
  57181. "LUT_INIT": "1111111001010100"
  57182. },
  57183. "attributes": {
  57184. "module_not_derived": "00000000000000000000000000000001",
  57185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  57186. },
  57187. "port_directions": {
  57188. "I0": "input",
  57189. "I1": "input",
  57190. "I2": "input",
  57191. "I3": "input",
  57192. "O": "output"
  57193. },
  57194. "connections": {
  57195. "I0": [ 2359 ],
  57196. "I1": [ 2557 ],
  57197. "I2": [ 2411 ],
  57198. "I3": [ 2404 ],
  57199. "O": [ 2433 ]
  57200. }
  57201. },
  57202. "cpu_I._zz_215__SB_LUT4_O_6_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  57203. "hide_name": 0,
  57204. "type": "SB_LUT4",
  57205. "parameters": {
  57206. "LUT_INIT": "1111110000110000"
  57207. },
  57208. "attributes": {
  57209. "module_not_derived": "00000000000000000000000000000001",
  57210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57211. },
  57212. "port_directions": {
  57213. "I0": "input",
  57214. "I1": "input",
  57215. "I2": "input",
  57216. "I3": "input",
  57217. "O": "output"
  57218. },
  57219. "connections": {
  57220. "I0": [ "0" ],
  57221. "I1": [ 2362 ],
  57222. "I2": [ 2423 ],
  57223. "I3": [ 2407 ],
  57224. "O": [ 2404 ]
  57225. }
  57226. },
  57227. "cpu_I._zz_215__SB_LUT4_O_6_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  57228. "hide_name": 0,
  57229. "type": "SB_LUT4",
  57230. "parameters": {
  57231. "LUT_INIT": "0000000000001111"
  57232. },
  57233. "attributes": {
  57234. "module_not_derived": "00000000000000000000000000000001",
  57235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  57236. },
  57237. "port_directions": {
  57238. "I0": "input",
  57239. "I1": "input",
  57240. "I2": "input",
  57241. "I3": "input",
  57242. "O": "output"
  57243. },
  57244. "connections": {
  57245. "I0": [ "0" ],
  57246. "I1": [ "0" ],
  57247. "I2": [ 2362 ],
  57248. "I3": [ 2410 ],
  57249. "O": [ 2557 ]
  57250. }
  57251. },
  57252. "cpu_I._zz_215__SB_LUT4_O_7": {
  57253. "hide_name": 0,
  57254. "type": "SB_LUT4",
  57255. "parameters": {
  57256. "LUT_INIT": "0011000011111100"
  57257. },
  57258. "attributes": {
  57259. "module_not_derived": "00000000000000000000000000000001",
  57260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57261. },
  57262. "port_directions": {
  57263. "I0": "input",
  57264. "I1": "input",
  57265. "I2": "input",
  57266. "I3": "input",
  57267. "O": "output"
  57268. },
  57269. "connections": {
  57270. "I0": [ "0" ],
  57271. "I1": [ 2344 ],
  57272. "I2": [ 2431 ],
  57273. "I3": [ 2558 ],
  57274. "O": [ 2559 ]
  57275. }
  57276. },
  57277. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O": {
  57278. "hide_name": 0,
  57279. "type": "SB_LUT4",
  57280. "parameters": {
  57281. "LUT_INIT": "1111001111000000"
  57282. },
  57283. "attributes": {
  57284. "module_not_derived": "00000000000000000000000000000001",
  57285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57286. },
  57287. "port_directions": {
  57288. "I0": "input",
  57289. "I1": "input",
  57290. "I2": "input",
  57291. "I3": "input",
  57292. "O": "output"
  57293. },
  57294. "connections": {
  57295. "I0": [ "0" ],
  57296. "I1": [ 2359 ],
  57297. "I2": [ 2560 ],
  57298. "I3": [ 2561 ],
  57299. "O": [ 2558 ]
  57300. }
  57301. },
  57302. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_1": {
  57303. "hide_name": 0,
  57304. "type": "SB_LUT4",
  57305. "parameters": {
  57306. "LUT_INIT": "0011000011111100"
  57307. },
  57308. "attributes": {
  57309. "module_not_derived": "00000000000000000000000000000001",
  57310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57311. },
  57312. "port_directions": {
  57313. "I0": "input",
  57314. "I1": "input",
  57315. "I2": "input",
  57316. "I3": "input",
  57317. "O": "output"
  57318. },
  57319. "connections": {
  57320. "I0": [ "0" ],
  57321. "I1": [ 2359 ],
  57322. "I2": [ 2410 ],
  57323. "I3": [ 2562 ],
  57324. "O": [ 2431 ]
  57325. }
  57326. },
  57327. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_I3": {
  57328. "hide_name": 0,
  57329. "type": "SB_LUT4",
  57330. "parameters": {
  57331. "LUT_INIT": "0000000000001111"
  57332. },
  57333. "attributes": {
  57334. "module_not_derived": "00000000000000000000000000000001",
  57335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  57336. },
  57337. "port_directions": {
  57338. "I0": "input",
  57339. "I1": "input",
  57340. "I2": "input",
  57341. "I3": "input",
  57342. "O": "output"
  57343. },
  57344. "connections": {
  57345. "I0": [ "0" ],
  57346. "I1": [ "0" ],
  57347. "I2": [ 2359 ],
  57348. "I3": [ 2560 ],
  57349. "O": [ 2346 ]
  57350. }
  57351. },
  57352. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O": {
  57353. "hide_name": 0,
  57354. "type": "SB_LUT4",
  57355. "parameters": {
  57356. "LUT_INIT": "0000100000101010"
  57357. },
  57358. "attributes": {
  57359. "module_not_derived": "00000000000000000000000000000001",
  57360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  57361. },
  57362. "port_directions": {
  57363. "I0": "input",
  57364. "I1": "input",
  57365. "I2": "input",
  57366. "I3": "input",
  57367. "O": "output"
  57368. },
  57369. "connections": {
  57370. "I0": [ 2359 ],
  57371. "I1": [ 2362 ],
  57372. "I2": [ 2563 ],
  57373. "I3": [ 2488 ],
  57374. "O": [ 2345 ]
  57375. }
  57376. },
  57377. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O_1": {
  57378. "hide_name": 0,
  57379. "type": "SB_LUT4",
  57380. "parameters": {
  57381. "LUT_INIT": "1111110000110000"
  57382. },
  57383. "attributes": {
  57384. "module_not_derived": "00000000000000000000000000000001",
  57385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57386. },
  57387. "port_directions": {
  57388. "I0": "input",
  57389. "I1": "input",
  57390. "I2": "input",
  57391. "I3": "input",
  57392. "O": "output"
  57393. },
  57394. "connections": {
  57395. "I0": [ "0" ],
  57396. "I1": [ 2359 ],
  57397. "I2": [ 2562 ],
  57398. "I3": [ 2561 ],
  57399. "O": [ 2347 ]
  57400. }
  57401. },
  57402. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O_2": {
  57403. "hide_name": 0,
  57404. "type": "SB_LUT4",
  57405. "parameters": {
  57406. "LUT_INIT": "0000001100000000"
  57407. },
  57408. "attributes": {
  57409. "module_not_derived": "00000000000000000000000000000001",
  57410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57411. },
  57412. "port_directions": {
  57413. "I0": "input",
  57414. "I1": "input",
  57415. "I2": "input",
  57416. "I3": "input",
  57417. "O": "output"
  57418. },
  57419. "connections": {
  57420. "I0": [ "0" ],
  57421. "I1": [ 2564 ],
  57422. "I2": [ 2565 ],
  57423. "I3": [ 2566 ],
  57424. "O": [ 2344 ]
  57425. }
  57426. },
  57427. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  57428. "hide_name": 0,
  57429. "type": "SB_LUT4",
  57430. "parameters": {
  57431. "LUT_INIT": "1111110000110000"
  57432. },
  57433. "attributes": {
  57434. "module_not_derived": "00000000000000000000000000000001",
  57435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57436. },
  57437. "port_directions": {
  57438. "I0": "input",
  57439. "I1": "input",
  57440. "I2": "input",
  57441. "I3": "input",
  57442. "O": "output"
  57443. },
  57444. "connections": {
  57445. "I0": [ "0" ],
  57446. "I1": [ 2362 ],
  57447. "I2": [ 2490 ],
  57448. "I3": [ 2489 ],
  57449. "O": [ 2560 ]
  57450. }
  57451. },
  57452. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  57453. "hide_name": 0,
  57454. "type": "SB_LUT4",
  57455. "parameters": {
  57456. "LUT_INIT": "1111110000110000"
  57457. },
  57458. "attributes": {
  57459. "module_not_derived": "00000000000000000000000000000001",
  57460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57461. },
  57462. "port_directions": {
  57463. "I0": "input",
  57464. "I1": "input",
  57465. "I2": "input",
  57466. "I3": "input",
  57467. "O": "output"
  57468. },
  57469. "connections": {
  57470. "I0": [ "0" ],
  57471. "I1": [ 2362 ],
  57472. "I2": [ 2506 ],
  57473. "I3": [ 2507 ],
  57474. "O": [ 2562 ]
  57475. }
  57476. },
  57477. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  57478. "hide_name": 0,
  57479. "type": "SB_LUT4",
  57480. "parameters": {
  57481. "LUT_INIT": "1111001111000000"
  57482. },
  57483. "attributes": {
  57484. "module_not_derived": "00000000000000000000000000000001",
  57485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57486. },
  57487. "port_directions": {
  57488. "I0": "input",
  57489. "I1": "input",
  57490. "I2": "input",
  57491. "I3": "input",
  57492. "O": "output"
  57493. },
  57494. "connections": {
  57495. "I0": [ "0" ],
  57496. "I1": [ 2362 ],
  57497. "I2": [ 2491 ],
  57498. "I3": [ 2494 ],
  57499. "O": [ 2561 ]
  57500. }
  57501. },
  57502. "cpu_I._zz_215__SB_LUT4_O_8": {
  57503. "hide_name": 0,
  57504. "type": "SB_LUT4",
  57505. "parameters": {
  57506. "LUT_INIT": "0011000011111100"
  57507. },
  57508. "attributes": {
  57509. "module_not_derived": "00000000000000000000000000000001",
  57510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57511. },
  57512. "port_directions": {
  57513. "I0": "input",
  57514. "I1": "input",
  57515. "I2": "input",
  57516. "I3": "input",
  57517. "O": "output"
  57518. },
  57519. "connections": {
  57520. "I0": [ "0" ],
  57521. "I1": [ 2344 ],
  57522. "I2": [ 2426 ],
  57523. "I3": [ 2567 ],
  57524. "O": [ 2568 ]
  57525. }
  57526. },
  57527. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O": {
  57528. "hide_name": 0,
  57529. "type": "SB_LUT4",
  57530. "parameters": {
  57531. "LUT_INIT": "1111001111000000"
  57532. },
  57533. "attributes": {
  57534. "module_not_derived": "00000000000000000000000000000001",
  57535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57536. },
  57537. "port_directions": {
  57538. "I0": "input",
  57539. "I1": "input",
  57540. "I2": "input",
  57541. "I3": "input",
  57542. "O": "output"
  57543. },
  57544. "connections": {
  57545. "I0": [ "0" ],
  57546. "I1": [ 2359 ],
  57547. "I2": [ 2517 ],
  57548. "I3": [ 2366 ],
  57549. "O": [ 2567 ]
  57550. }
  57551. },
  57552. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1": {
  57553. "hide_name": 0,
  57554. "type": "SB_LUT4",
  57555. "parameters": {
  57556. "LUT_INIT": "0011000011111100"
  57557. },
  57558. "attributes": {
  57559. "module_not_derived": "00000000000000000000000000000001",
  57560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57561. },
  57562. "port_directions": {
  57563. "I0": "input",
  57564. "I1": "input",
  57565. "I2": "input",
  57566. "I3": "input",
  57567. "O": "output"
  57568. },
  57569. "connections": {
  57570. "I0": [ "0" ],
  57571. "I1": [ 2359 ],
  57572. "I2": [ 2410 ],
  57573. "I3": [ 2569 ],
  57574. "O": [ 2426 ]
  57575. }
  57576. },
  57577. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_I2": {
  57578. "hide_name": 0,
  57579. "type": "SB_LUT4",
  57580. "parameters": {
  57581. "LUT_INIT": "1111110000110000"
  57582. },
  57583. "attributes": {
  57584. "module_not_derived": "00000000000000000000000000000001",
  57585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57586. },
  57587. "port_directions": {
  57588. "I0": "input",
  57589. "I1": "input",
  57590. "I2": "input",
  57591. "I3": "input",
  57592. "O": "output"
  57593. },
  57594. "connections": {
  57595. "I0": [ "0" ],
  57596. "I1": [ 2359 ],
  57597. "I2": [ 2569 ],
  57598. "I3": [ 2366 ],
  57599. "O": [ 2443 ]
  57600. }
  57601. },
  57602. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O": {
  57603. "hide_name": 0,
  57604. "type": "SB_LUT4",
  57605. "parameters": {
  57606. "LUT_INIT": "0010101000001000"
  57607. },
  57608. "attributes": {
  57609. "module_not_derived": "00000000000000000000000000000001",
  57610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  57611. },
  57612. "port_directions": {
  57613. "I0": "input",
  57614. "I1": "input",
  57615. "I2": "input",
  57616. "I3": "input",
  57617. "O": "output"
  57618. },
  57619. "connections": {
  57620. "I0": [ 2359 ],
  57621. "I1": [ 2362 ],
  57622. "I2": [ 2529 ],
  57623. "I3": [ 2516 ],
  57624. "O": [ 2441 ]
  57625. }
  57626. },
  57627. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1": {
  57628. "hide_name": 0,
  57629. "type": "SB_LUT4",
  57630. "parameters": {
  57631. "LUT_INIT": "0000111100000000"
  57632. },
  57633. "attributes": {
  57634. "module_not_derived": "00000000000000000000000000000001",
  57635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  57636. },
  57637. "port_directions": {
  57638. "I0": "input",
  57639. "I1": "input",
  57640. "I2": "input",
  57641. "I3": "input",
  57642. "O": "output"
  57643. },
  57644. "connections": {
  57645. "I0": [ "0" ],
  57646. "I1": [ "0" ],
  57647. "I2": [ 2359 ],
  57648. "I3": [ 2517 ],
  57649. "O": [ 2442 ]
  57650. }
  57651. },
  57652. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  57653. "hide_name": 0,
  57654. "type": "SB_LUT4",
  57655. "parameters": {
  57656. "LUT_INIT": "1100111100000011"
  57657. },
  57658. "attributes": {
  57659. "module_not_derived": "00000000000000000000000000000001",
  57660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57661. },
  57662. "port_directions": {
  57663. "I0": "input",
  57664. "I1": "input",
  57665. "I2": "input",
  57666. "I3": "input",
  57667. "O": "output"
  57668. },
  57669. "connections": {
  57670. "I0": [ "0" ],
  57671. "I1": [ 2362 ],
  57672. "I2": [ 2538 ],
  57673. "I3": [ 2539 ],
  57674. "O": [ 2569 ]
  57675. }
  57676. },
  57677. "cpu_I._zz_215__SB_LUT4_O_9": {
  57678. "hide_name": 0,
  57679. "type": "SB_LUT4",
  57680. "parameters": {
  57681. "LUT_INIT": "0011000011111100"
  57682. },
  57683. "attributes": {
  57684. "module_not_derived": "00000000000000000000000000000001",
  57685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57686. },
  57687. "port_directions": {
  57688. "I0": "input",
  57689. "I1": "input",
  57690. "I2": "input",
  57691. "I3": "input",
  57692. "O": "output"
  57693. },
  57694. "connections": {
  57695. "I0": [ "0" ],
  57696. "I1": [ 2344 ],
  57697. "I2": [ 2424 ],
  57698. "I3": [ 2570 ],
  57699. "O": [ 2571 ]
  57700. }
  57701. },
  57702. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O": {
  57703. "hide_name": 0,
  57704. "type": "SB_LUT4",
  57705. "parameters": {
  57706. "LUT_INIT": "1111001111000000"
  57707. },
  57708. "attributes": {
  57709. "module_not_derived": "00000000000000000000000000000001",
  57710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57711. },
  57712. "port_directions": {
  57713. "I0": "input",
  57714. "I1": "input",
  57715. "I2": "input",
  57716. "I3": "input",
  57717. "O": "output"
  57718. },
  57719. "connections": {
  57720. "I0": [ "0" ],
  57721. "I1": [ 2359 ],
  57722. "I2": [ 2572 ],
  57723. "I3": [ 2573 ],
  57724. "O": [ 2570 ]
  57725. }
  57726. },
  57727. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1": {
  57728. "hide_name": 0,
  57729. "type": "SB_LUT4",
  57730. "parameters": {
  57731. "LUT_INIT": "0011000011111100"
  57732. },
  57733. "attributes": {
  57734. "module_not_derived": "00000000000000000000000000000001",
  57735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57736. },
  57737. "port_directions": {
  57738. "I0": "input",
  57739. "I1": "input",
  57740. "I2": "input",
  57741. "I3": "input",
  57742. "O": "output"
  57743. },
  57744. "connections": {
  57745. "I0": [ "0" ],
  57746. "I1": [ 2359 ],
  57747. "I2": [ 2410 ],
  57748. "I3": [ 2574 ],
  57749. "O": [ 2424 ]
  57750. }
  57751. },
  57752. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2": {
  57753. "hide_name": 0,
  57754. "type": "SB_LUT4",
  57755. "parameters": {
  57756. "LUT_INIT": "1111110000110000"
  57757. },
  57758. "attributes": {
  57759. "module_not_derived": "00000000000000000000000000000001",
  57760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57761. },
  57762. "port_directions": {
  57763. "I0": "input",
  57764. "I1": "input",
  57765. "I2": "input",
  57766. "I3": "input",
  57767. "O": "output"
  57768. },
  57769. "connections": {
  57770. "I0": [ "0" ],
  57771. "I1": [ 2359 ],
  57772. "I2": [ 2574 ],
  57773. "I3": [ 2573 ],
  57774. "O": [ 2351 ]
  57775. }
  57776. },
  57777. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O": {
  57778. "hide_name": 0,
  57779. "type": "SB_LUT4",
  57780. "parameters": {
  57781. "LUT_INIT": "0000000000001111"
  57782. },
  57783. "attributes": {
  57784. "module_not_derived": "00000000000000000000000000000001",
  57785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  57786. },
  57787. "port_directions": {
  57788. "I0": "input",
  57789. "I1": "input",
  57790. "I2": "input",
  57791. "I3": "input",
  57792. "O": "output"
  57793. },
  57794. "connections": {
  57795. "I0": [ "0" ],
  57796. "I1": [ "0" ],
  57797. "I2": [ 2359 ],
  57798. "I3": [ 2572 ],
  57799. "O": [ 2350 ]
  57800. }
  57801. },
  57802. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1": {
  57803. "hide_name": 0,
  57804. "type": "SB_LUT4",
  57805. "parameters": {
  57806. "LUT_INIT": "0000100000101010"
  57807. },
  57808. "attributes": {
  57809. "module_not_derived": "00000000000000000000000000000001",
  57810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  57811. },
  57812. "port_directions": {
  57813. "I0": "input",
  57814. "I1": "input",
  57815. "I2": "input",
  57816. "I3": "input",
  57817. "O": "output"
  57818. },
  57819. "connections": {
  57820. "I0": [ 2359 ],
  57821. "I1": [ 2362 ],
  57822. "I2": [ 2575 ],
  57823. "I3": [ 2551 ],
  57824. "O": [ 2349 ]
  57825. }
  57826. },
  57827. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O": {
  57828. "hide_name": 0,
  57829. "type": "SB_LUT4",
  57830. "parameters": {
  57831. "LUT_INIT": "1111001111000000"
  57832. },
  57833. "attributes": {
  57834. "module_not_derived": "00000000000000000000000000000001",
  57835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57836. },
  57837. "port_directions": {
  57838. "I0": "input",
  57839. "I1": "input",
  57840. "I2": "input",
  57841. "I3": "input",
  57842. "O": "output"
  57843. },
  57844. "connections": {
  57845. "I0": [ "0" ],
  57846. "I1": [ 2367 ],
  57847. "I2": [ 2576 ],
  57848. "I3": [ 2534 ],
  57849. "O": [ 2575 ]
  57850. }
  57851. },
  57852. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_I2": {
  57853. "hide_name": 0,
  57854. "type": "SB_LUT4",
  57855. "parameters": {
  57856. "LUT_INIT": "1111001111000000"
  57857. },
  57858. "attributes": {
  57859. "module_not_derived": "00000000000000000000000000000001",
  57860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57861. },
  57862. "port_directions": {
  57863. "I0": "input",
  57864. "I1": "input",
  57865. "I2": "input",
  57866. "I3": "input",
  57867. "O": "output"
  57868. },
  57869. "connections": {
  57870. "I0": [ "0" ],
  57871. "I1": [ 2367 ],
  57872. "I2": [ 2577 ],
  57873. "I3": [ 2576 ],
  57874. "O": [ 2563 ]
  57875. }
  57876. },
  57877. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O": {
  57878. "hide_name": 0,
  57879. "type": "SB_LUT4",
  57880. "parameters": {
  57881. "LUT_INIT": "1111001111000000"
  57882. },
  57883. "attributes": {
  57884. "module_not_derived": "00000000000000000000000000000001",
  57885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57886. },
  57887. "port_directions": {
  57888. "I0": "input",
  57889. "I1": "input",
  57890. "I2": "input",
  57891. "I3": "input",
  57892. "O": "output"
  57893. },
  57894. "connections": {
  57895. "I0": [ "0" ],
  57896. "I1": [ 2367 ],
  57897. "I2": [ 2534 ],
  57898. "I3": [ 2533 ],
  57899. "O": [ 2488 ]
  57900. }
  57901. },
  57902. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O_1": {
  57903. "hide_name": 0,
  57904. "type": "SB_LUT4",
  57905. "parameters": {
  57906. "LUT_INIT": "0000001100000000"
  57907. },
  57908. "attributes": {
  57909. "module_not_derived": "00000000000000000000000000000001",
  57910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57911. },
  57912. "port_directions": {
  57913. "I0": "input",
  57914. "I1": "input",
  57915. "I2": "input",
  57916. "I3": "input",
  57917. "O": "output"
  57918. },
  57919. "connections": {
  57920. "I0": [ "0" ],
  57921. "I1": [ 2578 ],
  57922. "I2": [ 2579 ],
  57923. "I3": [ 2580 ],
  57924. "O": [ 2359 ]
  57925. }
  57926. },
  57927. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O_2": {
  57928. "hide_name": 0,
  57929. "type": "SB_LUT4",
  57930. "parameters": {
  57931. "LUT_INIT": "0000001100000000"
  57932. },
  57933. "attributes": {
  57934. "module_not_derived": "00000000000000000000000000000001",
  57935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57936. },
  57937. "port_directions": {
  57938. "I0": "input",
  57939. "I1": "input",
  57940. "I2": "input",
  57941. "I3": "input",
  57942. "O": "output"
  57943. },
  57944. "connections": {
  57945. "I0": [ "0" ],
  57946. "I1": [ 2581 ],
  57947. "I2": [ 2582 ],
  57948. "I3": [ 2583 ],
  57949. "O": [ 2362 ]
  57950. }
  57951. },
  57952. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  57953. "hide_name": 0,
  57954. "type": "SB_LUT4",
  57955. "parameters": {
  57956. "LUT_INIT": "1111001111000000"
  57957. },
  57958. "attributes": {
  57959. "module_not_derived": "00000000000000000000000000000001",
  57960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57961. },
  57962. "port_directions": {
  57963. "I0": "input",
  57964. "I1": "input",
  57965. "I2": "input",
  57966. "I3": "input",
  57967. "O": "output"
  57968. },
  57969. "connections": {
  57970. "I0": [ "0" ],
  57971. "I1": [ 2372 ],
  57972. "I2": [ 2468 ],
  57973. "I3": [ 2462 ],
  57974. "O": [ 2577 ]
  57975. }
  57976. },
  57977. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  57978. "hide_name": 0,
  57979. "type": "SB_LUT4",
  57980. "parameters": {
  57981. "LUT_INIT": "1111110000110000"
  57982. },
  57983. "attributes": {
  57984. "module_not_derived": "00000000000000000000000000000001",
  57985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  57986. },
  57987. "port_directions": {
  57988. "I0": "input",
  57989. "I1": "input",
  57990. "I2": "input",
  57991. "I3": "input",
  57992. "O": "output"
  57993. },
  57994. "connections": {
  57995. "I0": [ "0" ],
  57996. "I1": [ 2372 ],
  57997. "I2": [ 2465 ],
  57998. "I3": [ 2463 ],
  57999. "O": [ 2576 ]
  58000. }
  58001. },
  58002. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I3_SB_LUT4_O": {
  58003. "hide_name": 0,
  58004. "type": "SB_LUT4",
  58005. "parameters": {
  58006. "LUT_INIT": "1111110000110000"
  58007. },
  58008. "attributes": {
  58009. "module_not_derived": "00000000000000000000000000000001",
  58010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58011. },
  58012. "port_directions": {
  58013. "I0": "input",
  58014. "I1": "input",
  58015. "I2": "input",
  58016. "I3": "input",
  58017. "O": "output"
  58018. },
  58019. "connections": {
  58020. "I0": [ "0" ],
  58021. "I1": [ 2367 ],
  58022. "I2": [ 2501 ],
  58023. "I3": [ 2459 ],
  58024. "O": [ 2550 ]
  58025. }
  58026. },
  58027. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I3_SB_LUT4_O_1": {
  58028. "hide_name": 0,
  58029. "type": "SB_LUT4",
  58030. "parameters": {
  58031. "LUT_INIT": "1111001111000000"
  58032. },
  58033. "attributes": {
  58034. "module_not_derived": "00000000000000000000000000000001",
  58035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58036. },
  58037. "port_directions": {
  58038. "I0": "input",
  58039. "I1": "input",
  58040. "I2": "input",
  58041. "I3": "input",
  58042. "O": "output"
  58043. },
  58044. "connections": {
  58045. "I0": [ "0" ],
  58046. "I1": [ 2367 ],
  58047. "I2": [ 2533 ],
  58048. "I3": [ 2461 ],
  58049. "O": [ 2551 ]
  58050. }
  58051. },
  58052. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  58053. "hide_name": 0,
  58054. "type": "SB_LUT4",
  58055. "parameters": {
  58056. "LUT_INIT": "1100111100000011"
  58057. },
  58058. "attributes": {
  58059. "module_not_derived": "00000000000000000000000000000001",
  58060. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58061. },
  58062. "port_directions": {
  58063. "I0": "input",
  58064. "I1": "input",
  58065. "I2": "input",
  58066. "I3": "input",
  58067. "O": "output"
  58068. },
  58069. "connections": {
  58070. "I0": [ "0" ],
  58071. "I1": [ 2362 ],
  58072. "I2": [ 2584 ],
  58073. "I3": [ 2585 ],
  58074. "O": [ 2574 ]
  58075. }
  58076. },
  58077. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_I3": {
  58078. "hide_name": 0,
  58079. "type": "SB_LUT4",
  58080. "parameters": {
  58081. "LUT_INIT": "0000001111001111"
  58082. },
  58083. "attributes": {
  58084. "module_not_derived": "00000000000000000000000000000001",
  58085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58086. },
  58087. "port_directions": {
  58088. "I0": "input",
  58089. "I1": "input",
  58090. "I2": "input",
  58091. "I3": "input",
  58092. "O": "output"
  58093. },
  58094. "connections": {
  58095. "I0": [ "0" ],
  58096. "I1": [ 2362 ],
  58097. "I2": [ 2410 ],
  58098. "I3": [ 2584 ],
  58099. "O": [ 2479 ]
  58100. }
  58101. },
  58102. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_I3_O_SB_LUT4_O": {
  58103. "hide_name": 0,
  58104. "type": "SB_LUT4",
  58105. "parameters": {
  58106. "LUT_INIT": "1111110000110000"
  58107. },
  58108. "attributes": {
  58109. "module_not_derived": "00000000000000000000000000000001",
  58110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58111. },
  58112. "port_directions": {
  58113. "I0": "input",
  58114. "I1": "input",
  58115. "I2": "input",
  58116. "I3": "input",
  58117. "O": "output"
  58118. },
  58119. "connections": {
  58120. "I0": [ "0" ],
  58121. "I1": [ 2362 ],
  58122. "I2": [ 2585 ],
  58123. "I3": [ 2586 ],
  58124. "O": [ 2481 ]
  58125. }
  58126. },
  58127. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  58128. "hide_name": 0,
  58129. "type": "SB_LUT4",
  58130. "parameters": {
  58131. "LUT_INIT": "0011000011111100"
  58132. },
  58133. "attributes": {
  58134. "module_not_derived": "00000000000000000000000000000001",
  58135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58136. },
  58137. "port_directions": {
  58138. "I0": "input",
  58139. "I1": "input",
  58140. "I2": "input",
  58141. "I3": "input",
  58142. "O": "output"
  58143. },
  58144. "connections": {
  58145. "I0": [ "0" ],
  58146. "I1": [ 2367 ],
  58147. "I2": [ 2410 ],
  58148. "I3": [ 2508 ],
  58149. "O": [ 2584 ]
  58150. }
  58151. },
  58152. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  58153. "hide_name": 0,
  58154. "type": "SB_LUT4",
  58155. "parameters": {
  58156. "LUT_INIT": "1111110000110000"
  58157. },
  58158. "attributes": {
  58159. "module_not_derived": "00000000000000000000000000000001",
  58160. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58161. },
  58162. "port_directions": {
  58163. "I0": "input",
  58164. "I1": "input",
  58165. "I2": "input",
  58166. "I3": "input",
  58167. "O": "output"
  58168. },
  58169. "connections": {
  58170. "I0": [ "0" ],
  58171. "I1": [ 2372 ],
  58172. "I2": [ 2543 ],
  58173. "I3": [ 2544 ],
  58174. "O": [ 2508 ]
  58175. }
  58176. },
  58177. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1": {
  58178. "hide_name": 0,
  58179. "type": "SB_LUT4",
  58180. "parameters": {
  58181. "LUT_INIT": "1111110000110000"
  58182. },
  58183. "attributes": {
  58184. "module_not_derived": "00000000000000000000000000000001",
  58185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58186. },
  58187. "port_directions": {
  58188. "I0": "input",
  58189. "I1": "input",
  58190. "I2": "input",
  58191. "I3": "input",
  58192. "O": "output"
  58193. },
  58194. "connections": {
  58195. "I0": [ "0" ],
  58196. "I1": [ 2372 ],
  58197. "I2": [ 2545 ],
  58198. "I3": [ 2546 ],
  58199. "O": [ 2509 ]
  58200. }
  58201. },
  58202. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1_I2_SB_LUT4_O": {
  58203. "hide_name": 0,
  58204. "type": "SB_LUT4",
  58205. "parameters": {
  58206. "LUT_INIT": "0000001111001111"
  58207. },
  58208. "attributes": {
  58209. "module_not_derived": "00000000000000000000000000000001",
  58210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58211. },
  58212. "port_directions": {
  58213. "I0": "input",
  58214. "I1": "input",
  58215. "I2": "input",
  58216. "I3": "input",
  58217. "O": "output"
  58218. },
  58219. "connections": {
  58220. "I0": [ "0" ],
  58221. "I1": [ 2378 ],
  58222. "I2": [ 2473 ],
  58223. "I3": [ 2474 ],
  58224. "O": [ 2545 ]
  58225. }
  58226. },
  58227. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  58228. "hide_name": 0,
  58229. "type": "SB_LUT4",
  58230. "parameters": {
  58231. "LUT_INIT": "0000001111001111"
  58232. },
  58233. "attributes": {
  58234. "module_not_derived": "00000000000000000000000000000001",
  58235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58236. },
  58237. "port_directions": {
  58238. "I0": "input",
  58239. "I1": "input",
  58240. "I2": "input",
  58241. "I3": "input",
  58242. "O": "output"
  58243. },
  58244. "connections": {
  58245. "I0": [ "0" ],
  58246. "I1": [ 2378 ],
  58247. "I2": [ 2471 ],
  58248. "I3": [ 2472 ],
  58249. "O": [ 2546 ]
  58250. }
  58251. },
  58252. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  58253. "hide_name": 0,
  58254. "type": "SB_LUT4",
  58255. "parameters": {
  58256. "LUT_INIT": "1111110000110000"
  58257. },
  58258. "attributes": {
  58259. "module_not_derived": "00000000000000000000000000000001",
  58260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58261. },
  58262. "port_directions": {
  58263. "I0": "input",
  58264. "I1": "input",
  58265. "I2": "input",
  58266. "I3": "input",
  58267. "O": "output"
  58268. },
  58269. "connections": {
  58270. "I0": [ "0" ],
  58271. "I1": [ 2367 ],
  58272. "I2": [ 2509 ],
  58273. "I3": [ 2510 ],
  58274. "O": [ 2585 ]
  58275. }
  58276. },
  58277. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  58278. "hide_name": 0,
  58279. "type": "SB_LUT4",
  58280. "parameters": {
  58281. "LUT_INIT": "1111110000110000"
  58282. },
  58283. "attributes": {
  58284. "module_not_derived": "00000000000000000000000000000001",
  58285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58286. },
  58287. "port_directions": {
  58288. "I0": "input",
  58289. "I1": "input",
  58290. "I2": "input",
  58291. "I3": "input",
  58292. "O": "output"
  58293. },
  58294. "connections": {
  58295. "I0": [ "0" ],
  58296. "I1": [ 2367 ],
  58297. "I2": [ 2511 ],
  58298. "I3": [ 2492 ],
  58299. "O": [ 2586 ]
  58300. }
  58301. },
  58302. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  58303. "hide_name": 0,
  58304. "type": "SB_LUT4",
  58305. "parameters": {
  58306. "LUT_INIT": "1111110000110000"
  58307. },
  58308. "attributes": {
  58309. "module_not_derived": "00000000000000000000000000000001",
  58310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58311. },
  58312. "port_directions": {
  58313. "I0": "input",
  58314. "I1": "input",
  58315. "I2": "input",
  58316. "I3": "input",
  58317. "O": "output"
  58318. },
  58319. "connections": {
  58320. "I0": [ "0" ],
  58321. "I1": [ 2372 ],
  58322. "I2": [ 2381 ],
  58323. "I3": [ 2373 ],
  58324. "O": [ 2510 ]
  58325. }
  58326. },
  58327. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  58328. "hide_name": 0,
  58329. "type": "SB_LUT4",
  58330. "parameters": {
  58331. "LUT_INIT": "1111110000110000"
  58332. },
  58333. "attributes": {
  58334. "module_not_derived": "00000000000000000000000000000001",
  58335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58336. },
  58337. "port_directions": {
  58338. "I0": "input",
  58339. "I1": "input",
  58340. "I2": "input",
  58341. "I3": "input",
  58342. "O": "output"
  58343. },
  58344. "connections": {
  58345. "I0": [ "0" ],
  58346. "I1": [ 2372 ],
  58347. "I2": [ 2374 ],
  58348. "I3": [ 2376 ],
  58349. "O": [ 2511 ]
  58350. }
  58351. },
  58352. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  58353. "hide_name": 0,
  58354. "type": "SB_LUT4",
  58355. "parameters": {
  58356. "LUT_INIT": "1111110000110000"
  58357. },
  58358. "attributes": {
  58359. "module_not_derived": "00000000000000000000000000000001",
  58360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58361. },
  58362. "port_directions": {
  58363. "I0": "input",
  58364. "I1": "input",
  58365. "I2": "input",
  58366. "I3": "input",
  58367. "O": "output"
  58368. },
  58369. "connections": {
  58370. "I0": [ "0" ],
  58371. "I1": [ 2362 ],
  58372. "I2": [ 2552 ],
  58373. "I3": [ 2550 ],
  58374. "O": [ 2572 ]
  58375. }
  58376. },
  58377. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  58378. "hide_name": 0,
  58379. "type": "SB_LUT4",
  58380. "parameters": {
  58381. "LUT_INIT": "1111001111000000"
  58382. },
  58383. "attributes": {
  58384. "module_not_derived": "00000000000000000000000000000001",
  58385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58386. },
  58387. "port_directions": {
  58388. "I0": "input",
  58389. "I1": "input",
  58390. "I2": "input",
  58391. "I3": "input",
  58392. "O": "output"
  58393. },
  58394. "connections": {
  58395. "I0": [ "0" ],
  58396. "I1": [ 2362 ],
  58397. "I2": [ 2553 ],
  58398. "I3": [ 2586 ],
  58399. "O": [ 2573 ]
  58400. }
  58401. },
  58402. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  58403. "hide_name": 0,
  58404. "type": "SB_LUT4",
  58405. "parameters": {
  58406. "LUT_INIT": "1111001111000000"
  58407. },
  58408. "attributes": {
  58409. "module_not_derived": "00000000000000000000000000000001",
  58410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58411. },
  58412. "port_directions": {
  58413. "I0": "input",
  58414. "I1": "input",
  58415. "I2": "input",
  58416. "I3": "input",
  58417. "O": "output"
  58418. },
  58419. "connections": {
  58420. "I0": [ "0" ],
  58421. "I1": [ 2367 ],
  58422. "I2": [ 2500 ],
  58423. "I3": [ 2496 ],
  58424. "O": [ 2552 ]
  58425. }
  58426. },
  58427. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  58428. "hide_name": 0,
  58429. "type": "SB_LUT4",
  58430. "parameters": {
  58431. "LUT_INIT": "1111001111000000"
  58432. },
  58433. "attributes": {
  58434. "module_not_derived": "00000000000000000000000000000001",
  58435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58436. },
  58437. "port_directions": {
  58438. "I0": "input",
  58439. "I1": "input",
  58440. "I2": "input",
  58441. "I3": "input",
  58442. "O": "output"
  58443. },
  58444. "connections": {
  58445. "I0": [ "0" ],
  58446. "I1": [ 2367 ],
  58447. "I2": [ 2495 ],
  58448. "I3": [ 2493 ],
  58449. "O": [ 2553 ]
  58450. }
  58451. },
  58452. "cpu_I._zz_217__SB_LUT4_O": {
  58453. "hide_name": 0,
  58454. "type": "SB_LUT4",
  58455. "parameters": {
  58456. "LUT_INIT": "0000110000000000"
  58457. },
  58458. "attributes": {
  58459. "module_not_derived": "00000000000000000000000000000001",
  58460. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58461. },
  58462. "port_directions": {
  58463. "I0": "input",
  58464. "I1": "input",
  58465. "I2": "input",
  58466. "I3": "input",
  58467. "O": "output"
  58468. },
  58469. "connections": {
  58470. "I0": [ "0" ],
  58471. "I1": [ 1543 ],
  58472. "I2": [ 2328 ],
  58473. "I3": [ 2587 ],
  58474. "O": [ 2588 ]
  58475. }
  58476. },
  58477. "cpu_I._zz_217__SB_LUT4_O_I3_SB_LUT4_O": {
  58478. "hide_name": 0,
  58479. "type": "SB_LUT4",
  58480. "parameters": {
  58481. "LUT_INIT": "0000001000000000"
  58482. },
  58483. "attributes": {
  58484. "module_not_derived": "00000000000000000000000000000001",
  58485. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58486. },
  58487. "port_directions": {
  58488. "I0": "input",
  58489. "I1": "input",
  58490. "I2": "input",
  58491. "I3": "input",
  58492. "O": "output"
  58493. },
  58494. "connections": {
  58495. "I0": [ 1548 ],
  58496. "I1": [ 1536 ],
  58497. "I2": [ 1363 ],
  58498. "I3": [ 2329 ],
  58499. "O": [ 2587 ]
  58500. }
  58501. },
  58502. "cpu_I._zz_218__SB_DFFE_Q": {
  58503. "hide_name": 0,
  58504. "type": "SB_DFFE",
  58505. "parameters": {
  58506. },
  58507. "attributes": {
  58508. "module_not_derived": "00000000000000000000000000000001",
  58509. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  58510. },
  58511. "port_directions": {
  58512. "C": "input",
  58513. "D": "input",
  58514. "E": "input",
  58515. "Q": "output"
  58516. },
  58517. "connections": {
  58518. "C": [ 42 ],
  58519. "D": [ 1337 ],
  58520. "E": [ 1472 ],
  58521. "Q": [ 2329 ]
  58522. }
  58523. },
  58524. "cpu_I._zz_223__SB_LUT4_O": {
  58525. "hide_name": 0,
  58526. "type": "SB_LUT4",
  58527. "parameters": {
  58528. "LUT_INIT": "1111111110111000"
  58529. },
  58530. "attributes": {
  58531. "module_not_derived": "00000000000000000000000000000001",
  58532. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58533. },
  58534. "port_directions": {
  58535. "I0": "input",
  58536. "I1": "input",
  58537. "I2": "input",
  58538. "I3": "input",
  58539. "O": "output"
  58540. },
  58541. "connections": {
  58542. "I0": [ 1363 ],
  58543. "I1": [ 1364 ],
  58544. "I2": [ 2331 ],
  58545. "I3": [ 2589 ],
  58546. "O": [ 2590 ]
  58547. }
  58548. },
  58549. "cpu_I._zz_223__SB_LUT4_O_I3_SB_LUT4_O": {
  58550. "hide_name": 0,
  58551. "type": "SB_LUT4",
  58552. "parameters": {
  58553. "LUT_INIT": "1110111100000000"
  58554. },
  58555. "attributes": {
  58556. "module_not_derived": "00000000000000000000000000000001",
  58557. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58558. },
  58559. "port_directions": {
  58560. "I0": "input",
  58561. "I1": "input",
  58562. "I2": "input",
  58563. "I3": "input",
  58564. "O": "output"
  58565. },
  58566. "connections": {
  58567. "I0": [ 1537 ],
  58568. "I1": [ 1362 ],
  58569. "I2": [ 1363 ],
  58570. "I3": [ 1543 ],
  58571. "O": [ 2589 ]
  58572. }
  58573. },
  58574. "cpu_I._zz_224__SB_LUT4_O": {
  58575. "hide_name": 0,
  58576. "type": "SB_LUT4",
  58577. "parameters": {
  58578. "LUT_INIT": "0000000000000011"
  58579. },
  58580. "attributes": {
  58581. "module_not_derived": "00000000000000000000000000000001",
  58582. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  58583. },
  58584. "port_directions": {
  58585. "I0": "input",
  58586. "I1": "input",
  58587. "I2": "input",
  58588. "I3": "input",
  58589. "O": "output"
  58590. },
  58591. "connections": {
  58592. "I0": [ "0" ],
  58593. "I1": [ 1363 ],
  58594. "I2": [ 1543 ],
  58595. "I3": [ 1364 ],
  58596. "O": [ 2591 ]
  58597. }
  58598. },
  58599. "cpu_I._zz_269__SB_LUT4_O": {
  58600. "hide_name": 0,
  58601. "type": "SB_LUT4",
  58602. "parameters": {
  58603. "LUT_INIT": "0110100110010110"
  58604. },
  58605. "attributes": {
  58606. "module_not_derived": "00000000000000000000000000000001",
  58607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58608. },
  58609. "port_directions": {
  58610. "I0": "input",
  58611. "I1": "input",
  58612. "I2": "input",
  58613. "I3": "input",
  58614. "O": "output"
  58615. },
  58616. "connections": {
  58617. "I0": [ "0" ],
  58618. "I1": [ "0" ],
  58619. "I2": [ 2592 ],
  58620. "I3": [ 2593 ],
  58621. "O": [ 2594 ]
  58622. }
  58623. },
  58624. "cpu_I._zz_269__SB_LUT4_O_1": {
  58625. "hide_name": 0,
  58626. "type": "SB_LUT4",
  58627. "parameters": {
  58628. "LUT_INIT": "0110100110010110"
  58629. },
  58630. "attributes": {
  58631. "module_not_derived": "00000000000000000000000000000001",
  58632. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58633. },
  58634. "port_directions": {
  58635. "I0": "input",
  58636. "I1": "input",
  58637. "I2": "input",
  58638. "I3": "input",
  58639. "O": "output"
  58640. },
  58641. "connections": {
  58642. "I0": [ "0" ],
  58643. "I1": [ "0" ],
  58644. "I2": [ 2595 ],
  58645. "I3": [ 2596 ],
  58646. "O": [ 2597 ]
  58647. }
  58648. },
  58649. "cpu_I._zz_269__SB_LUT4_O_10": {
  58650. "hide_name": 0,
  58651. "type": "SB_LUT4",
  58652. "parameters": {
  58653. "LUT_INIT": "0110100110010110"
  58654. },
  58655. "attributes": {
  58656. "module_not_derived": "00000000000000000000000000000001",
  58657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58658. },
  58659. "port_directions": {
  58660. "I0": "input",
  58661. "I1": "input",
  58662. "I2": "input",
  58663. "I3": "input",
  58664. "O": "output"
  58665. },
  58666. "connections": {
  58667. "I0": [ "0" ],
  58668. "I1": [ "0" ],
  58669. "I2": [ 2598 ],
  58670. "I3": [ 2599 ],
  58671. "O": [ 2600 ]
  58672. }
  58673. },
  58674. "cpu_I._zz_269__SB_LUT4_O_10_I2_SB_LUT4_O": {
  58675. "hide_name": 0,
  58676. "type": "SB_LUT4",
  58677. "parameters": {
  58678. "LUT_INIT": "0100011110111000"
  58679. },
  58680. "attributes": {
  58681. "module_not_derived": "00000000000000000000000000000001",
  58682. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58683. },
  58684. "port_directions": {
  58685. "I0": "input",
  58686. "I1": "input",
  58687. "I2": "input",
  58688. "I3": "input",
  58689. "O": "output"
  58690. },
  58691. "connections": {
  58692. "I0": [ 2601 ],
  58693. "I1": [ 2602 ],
  58694. "I2": [ 2603 ],
  58695. "I3": [ 2604 ],
  58696. "O": [ 2598 ]
  58697. }
  58698. },
  58699. "cpu_I._zz_269__SB_LUT4_O_10_I3_SB_CARRY_CO": {
  58700. "hide_name": 0,
  58701. "type": "SB_CARRY",
  58702. "parameters": {
  58703. },
  58704. "attributes": {
  58705. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  58706. },
  58707. "port_directions": {
  58708. "CI": "input",
  58709. "CO": "output",
  58710. "I0": "input",
  58711. "I1": "input"
  58712. },
  58713. "connections": {
  58714. "CI": [ 2605 ],
  58715. "CO": [ 2599 ],
  58716. "I0": [ "0" ],
  58717. "I1": [ 2606 ]
  58718. }
  58719. },
  58720. "cpu_I._zz_269__SB_LUT4_O_11": {
  58721. "hide_name": 0,
  58722. "type": "SB_LUT4",
  58723. "parameters": {
  58724. "LUT_INIT": "0110100110010110"
  58725. },
  58726. "attributes": {
  58727. "module_not_derived": "00000000000000000000000000000001",
  58728. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58729. },
  58730. "port_directions": {
  58731. "I0": "input",
  58732. "I1": "input",
  58733. "I2": "input",
  58734. "I3": "input",
  58735. "O": "output"
  58736. },
  58737. "connections": {
  58738. "I0": [ "0" ],
  58739. "I1": [ "0" ],
  58740. "I2": [ 2607 ],
  58741. "I3": [ 2608 ],
  58742. "O": [ 2609 ]
  58743. }
  58744. },
  58745. "cpu_I._zz_269__SB_LUT4_O_11_I2_SB_LUT4_O": {
  58746. "hide_name": 0,
  58747. "type": "SB_LUT4",
  58748. "parameters": {
  58749. "LUT_INIT": "0100011110111000"
  58750. },
  58751. "attributes": {
  58752. "module_not_derived": "00000000000000000000000000000001",
  58753. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58754. },
  58755. "port_directions": {
  58756. "I0": "input",
  58757. "I1": "input",
  58758. "I2": "input",
  58759. "I3": "input",
  58760. "O": "output"
  58761. },
  58762. "connections": {
  58763. "I0": [ 2610 ],
  58764. "I1": [ 2602 ],
  58765. "I2": [ 2611 ],
  58766. "I3": [ 2604 ],
  58767. "O": [ 2607 ]
  58768. }
  58769. },
  58770. "cpu_I._zz_269__SB_LUT4_O_11_I3_SB_CARRY_CO": {
  58771. "hide_name": 0,
  58772. "type": "SB_CARRY",
  58773. "parameters": {
  58774. },
  58775. "attributes": {
  58776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  58777. },
  58778. "port_directions": {
  58779. "CI": "input",
  58780. "CO": "output",
  58781. "I0": "input",
  58782. "I1": "input"
  58783. },
  58784. "connections": {
  58785. "CI": [ 2599 ],
  58786. "CO": [ 2608 ],
  58787. "I0": [ "0" ],
  58788. "I1": [ 2598 ]
  58789. }
  58790. },
  58791. "cpu_I._zz_269__SB_LUT4_O_12": {
  58792. "hide_name": 0,
  58793. "type": "SB_LUT4",
  58794. "parameters": {
  58795. "LUT_INIT": "0110100110010110"
  58796. },
  58797. "attributes": {
  58798. "module_not_derived": "00000000000000000000000000000001",
  58799. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58800. },
  58801. "port_directions": {
  58802. "I0": "input",
  58803. "I1": "input",
  58804. "I2": "input",
  58805. "I3": "input",
  58806. "O": "output"
  58807. },
  58808. "connections": {
  58809. "I0": [ "0" ],
  58810. "I1": [ "0" ],
  58811. "I2": [ 2612 ],
  58812. "I3": [ 2613 ],
  58813. "O": [ 2614 ]
  58814. }
  58815. },
  58816. "cpu_I._zz_269__SB_LUT4_O_12_I2_SB_LUT4_O": {
  58817. "hide_name": 0,
  58818. "type": "SB_LUT4",
  58819. "parameters": {
  58820. "LUT_INIT": "0100011110111000"
  58821. },
  58822. "attributes": {
  58823. "module_not_derived": "00000000000000000000000000000001",
  58824. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58825. },
  58826. "port_directions": {
  58827. "I0": "input",
  58828. "I1": "input",
  58829. "I2": "input",
  58830. "I3": "input",
  58831. "O": "output"
  58832. },
  58833. "connections": {
  58834. "I0": [ 2615 ],
  58835. "I1": [ 2602 ],
  58836. "I2": [ 2616 ],
  58837. "I3": [ 2604 ],
  58838. "O": [ 2612 ]
  58839. }
  58840. },
  58841. "cpu_I._zz_269__SB_LUT4_O_12_I3_SB_CARRY_CO": {
  58842. "hide_name": 0,
  58843. "type": "SB_CARRY",
  58844. "parameters": {
  58845. },
  58846. "attributes": {
  58847. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  58848. },
  58849. "port_directions": {
  58850. "CI": "input",
  58851. "CO": "output",
  58852. "I0": "input",
  58853. "I1": "input"
  58854. },
  58855. "connections": {
  58856. "CI": [ 2608 ],
  58857. "CO": [ 2613 ],
  58858. "I0": [ "0" ],
  58859. "I1": [ 2607 ]
  58860. }
  58861. },
  58862. "cpu_I._zz_269__SB_LUT4_O_13": {
  58863. "hide_name": 0,
  58864. "type": "SB_LUT4",
  58865. "parameters": {
  58866. "LUT_INIT": "0110100110010110"
  58867. },
  58868. "attributes": {
  58869. "module_not_derived": "00000000000000000000000000000001",
  58870. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58871. },
  58872. "port_directions": {
  58873. "I0": "input",
  58874. "I1": "input",
  58875. "I2": "input",
  58876. "I3": "input",
  58877. "O": "output"
  58878. },
  58879. "connections": {
  58880. "I0": [ "0" ],
  58881. "I1": [ "0" ],
  58882. "I2": [ 2617 ],
  58883. "I3": [ 2618 ],
  58884. "O": [ 2619 ]
  58885. }
  58886. },
  58887. "cpu_I._zz_269__SB_LUT4_O_13_I2_SB_LUT4_O": {
  58888. "hide_name": 0,
  58889. "type": "SB_LUT4",
  58890. "parameters": {
  58891. "LUT_INIT": "0100011110111000"
  58892. },
  58893. "attributes": {
  58894. "module_not_derived": "00000000000000000000000000000001",
  58895. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58896. },
  58897. "port_directions": {
  58898. "I0": "input",
  58899. "I1": "input",
  58900. "I2": "input",
  58901. "I3": "input",
  58902. "O": "output"
  58903. },
  58904. "connections": {
  58905. "I0": [ 2620 ],
  58906. "I1": [ 2602 ],
  58907. "I2": [ 2621 ],
  58908. "I3": [ 2604 ],
  58909. "O": [ 2617 ]
  58910. }
  58911. },
  58912. "cpu_I._zz_269__SB_LUT4_O_13_I3_SB_CARRY_CO": {
  58913. "hide_name": 0,
  58914. "type": "SB_CARRY",
  58915. "parameters": {
  58916. },
  58917. "attributes": {
  58918. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  58919. },
  58920. "port_directions": {
  58921. "CI": "input",
  58922. "CO": "output",
  58923. "I0": "input",
  58924. "I1": "input"
  58925. },
  58926. "connections": {
  58927. "CI": [ 2613 ],
  58928. "CO": [ 2618 ],
  58929. "I0": [ "0" ],
  58930. "I1": [ 2612 ]
  58931. }
  58932. },
  58933. "cpu_I._zz_269__SB_LUT4_O_14": {
  58934. "hide_name": 0,
  58935. "type": "SB_LUT4",
  58936. "parameters": {
  58937. "LUT_INIT": "0110100110010110"
  58938. },
  58939. "attributes": {
  58940. "module_not_derived": "00000000000000000000000000000001",
  58941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58942. },
  58943. "port_directions": {
  58944. "I0": "input",
  58945. "I1": "input",
  58946. "I2": "input",
  58947. "I3": "input",
  58948. "O": "output"
  58949. },
  58950. "connections": {
  58951. "I0": [ "0" ],
  58952. "I1": [ "0" ],
  58953. "I2": [ 2622 ],
  58954. "I3": [ 2623 ],
  58955. "O": [ 2624 ]
  58956. }
  58957. },
  58958. "cpu_I._zz_269__SB_LUT4_O_14_I2_SB_LUT4_O": {
  58959. "hide_name": 0,
  58960. "type": "SB_LUT4",
  58961. "parameters": {
  58962. "LUT_INIT": "0100011110111000"
  58963. },
  58964. "attributes": {
  58965. "module_not_derived": "00000000000000000000000000000001",
  58966. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  58967. },
  58968. "port_directions": {
  58969. "I0": "input",
  58970. "I1": "input",
  58971. "I2": "input",
  58972. "I3": "input",
  58973. "O": "output"
  58974. },
  58975. "connections": {
  58976. "I0": [ 2625 ],
  58977. "I1": [ 2602 ],
  58978. "I2": [ 2626 ],
  58979. "I3": [ 2604 ],
  58980. "O": [ 2622 ]
  58981. }
  58982. },
  58983. "cpu_I._zz_269__SB_LUT4_O_14_I3_SB_CARRY_CO": {
  58984. "hide_name": 0,
  58985. "type": "SB_CARRY",
  58986. "parameters": {
  58987. },
  58988. "attributes": {
  58989. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  58990. },
  58991. "port_directions": {
  58992. "CI": "input",
  58993. "CO": "output",
  58994. "I0": "input",
  58995. "I1": "input"
  58996. },
  58997. "connections": {
  58998. "CI": [ 2618 ],
  58999. "CO": [ 2623 ],
  59000. "I0": [ "0" ],
  59001. "I1": [ 2617 ]
  59002. }
  59003. },
  59004. "cpu_I._zz_269__SB_LUT4_O_15": {
  59005. "hide_name": 0,
  59006. "type": "SB_LUT4",
  59007. "parameters": {
  59008. "LUT_INIT": "0110100110010110"
  59009. },
  59010. "attributes": {
  59011. "module_not_derived": "00000000000000000000000000000001",
  59012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59013. },
  59014. "port_directions": {
  59015. "I0": "input",
  59016. "I1": "input",
  59017. "I2": "input",
  59018. "I3": "input",
  59019. "O": "output"
  59020. },
  59021. "connections": {
  59022. "I0": [ "0" ],
  59023. "I1": [ "0" ],
  59024. "I2": [ 2627 ],
  59025. "I3": [ 2628 ],
  59026. "O": [ 2629 ]
  59027. }
  59028. },
  59029. "cpu_I._zz_269__SB_LUT4_O_15_I2_SB_LUT4_O": {
  59030. "hide_name": 0,
  59031. "type": "SB_LUT4",
  59032. "parameters": {
  59033. "LUT_INIT": "0100011110111000"
  59034. },
  59035. "attributes": {
  59036. "module_not_derived": "00000000000000000000000000000001",
  59037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59038. },
  59039. "port_directions": {
  59040. "I0": "input",
  59041. "I1": "input",
  59042. "I2": "input",
  59043. "I3": "input",
  59044. "O": "output"
  59045. },
  59046. "connections": {
  59047. "I0": [ 2630 ],
  59048. "I1": [ 2602 ],
  59049. "I2": [ 2631 ],
  59050. "I3": [ 2604 ],
  59051. "O": [ 2627 ]
  59052. }
  59053. },
  59054. "cpu_I._zz_269__SB_LUT4_O_15_I3_SB_CARRY_CO": {
  59055. "hide_name": 0,
  59056. "type": "SB_CARRY",
  59057. "parameters": {
  59058. },
  59059. "attributes": {
  59060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59061. },
  59062. "port_directions": {
  59063. "CI": "input",
  59064. "CO": "output",
  59065. "I0": "input",
  59066. "I1": "input"
  59067. },
  59068. "connections": {
  59069. "CI": [ 2623 ],
  59070. "CO": [ 2628 ],
  59071. "I0": [ "0" ],
  59072. "I1": [ 2622 ]
  59073. }
  59074. },
  59075. "cpu_I._zz_269__SB_LUT4_O_16": {
  59076. "hide_name": 0,
  59077. "type": "SB_LUT4",
  59078. "parameters": {
  59079. "LUT_INIT": "0110100110010110"
  59080. },
  59081. "attributes": {
  59082. "module_not_derived": "00000000000000000000000000000001",
  59083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59084. },
  59085. "port_directions": {
  59086. "I0": "input",
  59087. "I1": "input",
  59088. "I2": "input",
  59089. "I3": "input",
  59090. "O": "output"
  59091. },
  59092. "connections": {
  59093. "I0": [ "0" ],
  59094. "I1": [ "0" ],
  59095. "I2": [ 2632 ],
  59096. "I3": [ 2633 ],
  59097. "O": [ 2634 ]
  59098. }
  59099. },
  59100. "cpu_I._zz_269__SB_LUT4_O_16_I2_SB_LUT4_O": {
  59101. "hide_name": 0,
  59102. "type": "SB_LUT4",
  59103. "parameters": {
  59104. "LUT_INIT": "0100011110111000"
  59105. },
  59106. "attributes": {
  59107. "module_not_derived": "00000000000000000000000000000001",
  59108. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59109. },
  59110. "port_directions": {
  59111. "I0": "input",
  59112. "I1": "input",
  59113. "I2": "input",
  59114. "I3": "input",
  59115. "O": "output"
  59116. },
  59117. "connections": {
  59118. "I0": [ 2635 ],
  59119. "I1": [ 2602 ],
  59120. "I2": [ 2636 ],
  59121. "I3": [ 2604 ],
  59122. "O": [ 2632 ]
  59123. }
  59124. },
  59125. "cpu_I._zz_269__SB_LUT4_O_16_I3_SB_CARRY_CO": {
  59126. "hide_name": 0,
  59127. "type": "SB_CARRY",
  59128. "parameters": {
  59129. },
  59130. "attributes": {
  59131. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59132. },
  59133. "port_directions": {
  59134. "CI": "input",
  59135. "CO": "output",
  59136. "I0": "input",
  59137. "I1": "input"
  59138. },
  59139. "connections": {
  59140. "CI": [ 2628 ],
  59141. "CO": [ 2633 ],
  59142. "I0": [ "0" ],
  59143. "I1": [ 2627 ]
  59144. }
  59145. },
  59146. "cpu_I._zz_269__SB_LUT4_O_17": {
  59147. "hide_name": 0,
  59148. "type": "SB_LUT4",
  59149. "parameters": {
  59150. "LUT_INIT": "0110100110010110"
  59151. },
  59152. "attributes": {
  59153. "module_not_derived": "00000000000000000000000000000001",
  59154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59155. },
  59156. "port_directions": {
  59157. "I0": "input",
  59158. "I1": "input",
  59159. "I2": "input",
  59160. "I3": "input",
  59161. "O": "output"
  59162. },
  59163. "connections": {
  59164. "I0": [ "0" ],
  59165. "I1": [ "0" ],
  59166. "I2": [ 2637 ],
  59167. "I3": [ 2638 ],
  59168. "O": [ 2639 ]
  59169. }
  59170. },
  59171. "cpu_I._zz_269__SB_LUT4_O_17_I2_SB_LUT4_O": {
  59172. "hide_name": 0,
  59173. "type": "SB_LUT4",
  59174. "parameters": {
  59175. "LUT_INIT": "0100011110111000"
  59176. },
  59177. "attributes": {
  59178. "module_not_derived": "00000000000000000000000000000001",
  59179. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59180. },
  59181. "port_directions": {
  59182. "I0": "input",
  59183. "I1": "input",
  59184. "I2": "input",
  59185. "I3": "input",
  59186. "O": "output"
  59187. },
  59188. "connections": {
  59189. "I0": [ 2640 ],
  59190. "I1": [ 2602 ],
  59191. "I2": [ 2641 ],
  59192. "I3": [ 2604 ],
  59193. "O": [ 2637 ]
  59194. }
  59195. },
  59196. "cpu_I._zz_269__SB_LUT4_O_17_I3_SB_CARRY_CO": {
  59197. "hide_name": 0,
  59198. "type": "SB_CARRY",
  59199. "parameters": {
  59200. },
  59201. "attributes": {
  59202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59203. },
  59204. "port_directions": {
  59205. "CI": "input",
  59206. "CO": "output",
  59207. "I0": "input",
  59208. "I1": "input"
  59209. },
  59210. "connections": {
  59211. "CI": [ 2633 ],
  59212. "CO": [ 2638 ],
  59213. "I0": [ "0" ],
  59214. "I1": [ 2632 ]
  59215. }
  59216. },
  59217. "cpu_I._zz_269__SB_LUT4_O_18": {
  59218. "hide_name": 0,
  59219. "type": "SB_LUT4",
  59220. "parameters": {
  59221. "LUT_INIT": "0110100110010110"
  59222. },
  59223. "attributes": {
  59224. "module_not_derived": "00000000000000000000000000000001",
  59225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59226. },
  59227. "port_directions": {
  59228. "I0": "input",
  59229. "I1": "input",
  59230. "I2": "input",
  59231. "I3": "input",
  59232. "O": "output"
  59233. },
  59234. "connections": {
  59235. "I0": [ "0" ],
  59236. "I1": [ "0" ],
  59237. "I2": [ 2642 ],
  59238. "I3": [ 2643 ],
  59239. "O": [ 2644 ]
  59240. }
  59241. },
  59242. "cpu_I._zz_269__SB_LUT4_O_18_I2_SB_LUT4_O": {
  59243. "hide_name": 0,
  59244. "type": "SB_LUT4",
  59245. "parameters": {
  59246. "LUT_INIT": "0100011110111000"
  59247. },
  59248. "attributes": {
  59249. "module_not_derived": "00000000000000000000000000000001",
  59250. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59251. },
  59252. "port_directions": {
  59253. "I0": "input",
  59254. "I1": "input",
  59255. "I2": "input",
  59256. "I3": "input",
  59257. "O": "output"
  59258. },
  59259. "connections": {
  59260. "I0": [ 2645 ],
  59261. "I1": [ 2602 ],
  59262. "I2": [ 2646 ],
  59263. "I3": [ 2604 ],
  59264. "O": [ 2642 ]
  59265. }
  59266. },
  59267. "cpu_I._zz_269__SB_LUT4_O_18_I3_SB_CARRY_CO": {
  59268. "hide_name": 0,
  59269. "type": "SB_CARRY",
  59270. "parameters": {
  59271. },
  59272. "attributes": {
  59273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59274. },
  59275. "port_directions": {
  59276. "CI": "input",
  59277. "CO": "output",
  59278. "I0": "input",
  59279. "I1": "input"
  59280. },
  59281. "connections": {
  59282. "CI": [ 2638 ],
  59283. "CO": [ 2643 ],
  59284. "I0": [ "0" ],
  59285. "I1": [ 2637 ]
  59286. }
  59287. },
  59288. "cpu_I._zz_269__SB_LUT4_O_19": {
  59289. "hide_name": 0,
  59290. "type": "SB_LUT4",
  59291. "parameters": {
  59292. "LUT_INIT": "0110100110010110"
  59293. },
  59294. "attributes": {
  59295. "module_not_derived": "00000000000000000000000000000001",
  59296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59297. },
  59298. "port_directions": {
  59299. "I0": "input",
  59300. "I1": "input",
  59301. "I2": "input",
  59302. "I3": "input",
  59303. "O": "output"
  59304. },
  59305. "connections": {
  59306. "I0": [ "0" ],
  59307. "I1": [ "0" ],
  59308. "I2": [ 2647 ],
  59309. "I3": [ 2648 ],
  59310. "O": [ 2649 ]
  59311. }
  59312. },
  59313. "cpu_I._zz_269__SB_LUT4_O_19_I2_SB_LUT4_O": {
  59314. "hide_name": 0,
  59315. "type": "SB_LUT4",
  59316. "parameters": {
  59317. "LUT_INIT": "0100011110111000"
  59318. },
  59319. "attributes": {
  59320. "module_not_derived": "00000000000000000000000000000001",
  59321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59322. },
  59323. "port_directions": {
  59324. "I0": "input",
  59325. "I1": "input",
  59326. "I2": "input",
  59327. "I3": "input",
  59328. "O": "output"
  59329. },
  59330. "connections": {
  59331. "I0": [ 2650 ],
  59332. "I1": [ 2602 ],
  59333. "I2": [ 2651 ],
  59334. "I3": [ 2604 ],
  59335. "O": [ 2647 ]
  59336. }
  59337. },
  59338. "cpu_I._zz_269__SB_LUT4_O_19_I3_SB_CARRY_CO": {
  59339. "hide_name": 0,
  59340. "type": "SB_CARRY",
  59341. "parameters": {
  59342. },
  59343. "attributes": {
  59344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59345. },
  59346. "port_directions": {
  59347. "CI": "input",
  59348. "CO": "output",
  59349. "I0": "input",
  59350. "I1": "input"
  59351. },
  59352. "connections": {
  59353. "CI": [ 2643 ],
  59354. "CO": [ 2648 ],
  59355. "I0": [ "0" ],
  59356. "I1": [ 2642 ]
  59357. }
  59358. },
  59359. "cpu_I._zz_269__SB_LUT4_O_1_I2_SB_LUT4_O": {
  59360. "hide_name": 0,
  59361. "type": "SB_LUT4",
  59362. "parameters": {
  59363. "LUT_INIT": "0010011111011000"
  59364. },
  59365. "attributes": {
  59366. "module_not_derived": "00000000000000000000000000000001",
  59367. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59368. },
  59369. "port_directions": {
  59370. "I0": "input",
  59371. "I1": "input",
  59372. "I2": "input",
  59373. "I3": "input",
  59374. "O": "output"
  59375. },
  59376. "connections": {
  59377. "I0": [ 2602 ],
  59378. "I1": [ 2652 ],
  59379. "I2": [ 2653 ],
  59380. "I3": [ 2604 ],
  59381. "O": [ 2595 ]
  59382. }
  59383. },
  59384. "cpu_I._zz_269__SB_LUT4_O_1_I3_SB_CARRY_CO": {
  59385. "hide_name": 0,
  59386. "type": "SB_CARRY",
  59387. "parameters": {
  59388. },
  59389. "attributes": {
  59390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59391. },
  59392. "port_directions": {
  59393. "CI": "input",
  59394. "CO": "output",
  59395. "I0": "input",
  59396. "I1": "input"
  59397. },
  59398. "connections": {
  59399. "CI": [ 2654 ],
  59400. "CO": [ 2596 ],
  59401. "I0": [ "0" ],
  59402. "I1": [ 2655 ]
  59403. }
  59404. },
  59405. "cpu_I._zz_269__SB_LUT4_O_2": {
  59406. "hide_name": 0,
  59407. "type": "SB_LUT4",
  59408. "parameters": {
  59409. "LUT_INIT": "0110100110010110"
  59410. },
  59411. "attributes": {
  59412. "module_not_derived": "00000000000000000000000000000001",
  59413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59414. },
  59415. "port_directions": {
  59416. "I0": "input",
  59417. "I1": "input",
  59418. "I2": "input",
  59419. "I3": "input",
  59420. "O": "output"
  59421. },
  59422. "connections": {
  59423. "I0": [ "0" ],
  59424. "I1": [ "0" ],
  59425. "I2": [ 2656 ],
  59426. "I3": [ 2657 ],
  59427. "O": [ 2658 ]
  59428. }
  59429. },
  59430. "cpu_I._zz_269__SB_LUT4_O_20": {
  59431. "hide_name": 0,
  59432. "type": "SB_LUT4",
  59433. "parameters": {
  59434. "LUT_INIT": "0110100110010110"
  59435. },
  59436. "attributes": {
  59437. "module_not_derived": "00000000000000000000000000000001",
  59438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59439. },
  59440. "port_directions": {
  59441. "I0": "input",
  59442. "I1": "input",
  59443. "I2": "input",
  59444. "I3": "input",
  59445. "O": "output"
  59446. },
  59447. "connections": {
  59448. "I0": [ "0" ],
  59449. "I1": [ "0" ],
  59450. "I2": [ 2659 ],
  59451. "I3": [ 2660 ],
  59452. "O": [ 2661 ]
  59453. }
  59454. },
  59455. "cpu_I._zz_269__SB_LUT4_O_20_I2_SB_LUT4_O": {
  59456. "hide_name": 0,
  59457. "type": "SB_LUT4",
  59458. "parameters": {
  59459. "LUT_INIT": "0100011110111000"
  59460. },
  59461. "attributes": {
  59462. "module_not_derived": "00000000000000000000000000000001",
  59463. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59464. },
  59465. "port_directions": {
  59466. "I0": "input",
  59467. "I1": "input",
  59468. "I2": "input",
  59469. "I3": "input",
  59470. "O": "output"
  59471. },
  59472. "connections": {
  59473. "I0": [ 2662 ],
  59474. "I1": [ 2602 ],
  59475. "I2": [ 2663 ],
  59476. "I3": [ 2604 ],
  59477. "O": [ 2659 ]
  59478. }
  59479. },
  59480. "cpu_I._zz_269__SB_LUT4_O_20_I3_SB_CARRY_CO": {
  59481. "hide_name": 0,
  59482. "type": "SB_CARRY",
  59483. "parameters": {
  59484. },
  59485. "attributes": {
  59486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59487. },
  59488. "port_directions": {
  59489. "CI": "input",
  59490. "CO": "output",
  59491. "I0": "input",
  59492. "I1": "input"
  59493. },
  59494. "connections": {
  59495. "CI": [ 2648 ],
  59496. "CO": [ 2660 ],
  59497. "I0": [ "0" ],
  59498. "I1": [ 2647 ]
  59499. }
  59500. },
  59501. "cpu_I._zz_269__SB_LUT4_O_21": {
  59502. "hide_name": 0,
  59503. "type": "SB_LUT4",
  59504. "parameters": {
  59505. "LUT_INIT": "0110100110010110"
  59506. },
  59507. "attributes": {
  59508. "module_not_derived": "00000000000000000000000000000001",
  59509. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59510. },
  59511. "port_directions": {
  59512. "I0": "input",
  59513. "I1": "input",
  59514. "I2": "input",
  59515. "I3": "input",
  59516. "O": "output"
  59517. },
  59518. "connections": {
  59519. "I0": [ "0" ],
  59520. "I1": [ "0" ],
  59521. "I2": [ 2664 ],
  59522. "I3": [ 2665 ],
  59523. "O": [ 2666 ]
  59524. }
  59525. },
  59526. "cpu_I._zz_269__SB_LUT4_O_21_I2_SB_LUT4_O": {
  59527. "hide_name": 0,
  59528. "type": "SB_LUT4",
  59529. "parameters": {
  59530. "LUT_INIT": "0010011111011000"
  59531. },
  59532. "attributes": {
  59533. "module_not_derived": "00000000000000000000000000000001",
  59534. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59535. },
  59536. "port_directions": {
  59537. "I0": "input",
  59538. "I1": "input",
  59539. "I2": "input",
  59540. "I3": "input",
  59541. "O": "output"
  59542. },
  59543. "connections": {
  59544. "I0": [ 2602 ],
  59545. "I1": [ 2667 ],
  59546. "I2": [ 2668 ],
  59547. "I3": [ 2604 ],
  59548. "O": [ 2664 ]
  59549. }
  59550. },
  59551. "cpu_I._zz_269__SB_LUT4_O_21_I3_SB_CARRY_CO": {
  59552. "hide_name": 0,
  59553. "type": "SB_CARRY",
  59554. "parameters": {
  59555. },
  59556. "attributes": {
  59557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59558. },
  59559. "port_directions": {
  59560. "CI": "input",
  59561. "CO": "output",
  59562. "I0": "input",
  59563. "I1": "input"
  59564. },
  59565. "connections": {
  59566. "CI": [ "0" ],
  59567. "CO": [ 2665 ],
  59568. "I0": [ 2604 ],
  59569. "I1": [ 2669 ]
  59570. }
  59571. },
  59572. "cpu_I._zz_269__SB_LUT4_O_21_I3_SB_CARRY_CO_I1_SB_LUT4_O": {
  59573. "hide_name": 0,
  59574. "type": "SB_LUT4",
  59575. "parameters": {
  59576. "LUT_INIT": "0000111111110000"
  59577. },
  59578. "attributes": {
  59579. "module_not_derived": "00000000000000000000000000000001",
  59580. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  59581. },
  59582. "port_directions": {
  59583. "I0": "input",
  59584. "I1": "input",
  59585. "I2": "input",
  59586. "I3": "input",
  59587. "O": "output"
  59588. },
  59589. "connections": {
  59590. "I0": [ "0" ],
  59591. "I1": [ "0" ],
  59592. "I2": [ 2604 ],
  59593. "I3": [ 2670 ],
  59594. "O": [ 2669 ]
  59595. }
  59596. },
  59597. "cpu_I._zz_269__SB_LUT4_O_22": {
  59598. "hide_name": 0,
  59599. "type": "SB_LUT4",
  59600. "parameters": {
  59601. "LUT_INIT": "0110100110010110"
  59602. },
  59603. "attributes": {
  59604. "module_not_derived": "00000000000000000000000000000001",
  59605. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59606. },
  59607. "port_directions": {
  59608. "I0": "input",
  59609. "I1": "input",
  59610. "I2": "input",
  59611. "I3": "input",
  59612. "O": "output"
  59613. },
  59614. "connections": {
  59615. "I0": [ "0" ],
  59616. "I1": [ "0" ],
  59617. "I2": [ 2671 ],
  59618. "I3": [ 2672 ],
  59619. "O": [ 2673 ]
  59620. }
  59621. },
  59622. "cpu_I._zz_269__SB_LUT4_O_22_I2_SB_LUT4_O": {
  59623. "hide_name": 0,
  59624. "type": "SB_LUT4",
  59625. "parameters": {
  59626. "LUT_INIT": "0100011110111000"
  59627. },
  59628. "attributes": {
  59629. "module_not_derived": "00000000000000000000000000000001",
  59630. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59631. },
  59632. "port_directions": {
  59633. "I0": "input",
  59634. "I1": "input",
  59635. "I2": "input",
  59636. "I3": "input",
  59637. "O": "output"
  59638. },
  59639. "connections": {
  59640. "I0": [ 2674 ],
  59641. "I1": [ 2602 ],
  59642. "I2": [ 2675 ],
  59643. "I3": [ 2604 ],
  59644. "O": [ 2671 ]
  59645. }
  59646. },
  59647. "cpu_I._zz_269__SB_LUT4_O_22_I3_SB_CARRY_CO": {
  59648. "hide_name": 0,
  59649. "type": "SB_CARRY",
  59650. "parameters": {
  59651. },
  59652. "attributes": {
  59653. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59654. },
  59655. "port_directions": {
  59656. "CI": "input",
  59657. "CO": "output",
  59658. "I0": "input",
  59659. "I1": "input"
  59660. },
  59661. "connections": {
  59662. "CI": [ 2660 ],
  59663. "CO": [ 2672 ],
  59664. "I0": [ "0" ],
  59665. "I1": [ 2659 ]
  59666. }
  59667. },
  59668. "cpu_I._zz_269__SB_LUT4_O_23": {
  59669. "hide_name": 0,
  59670. "type": "SB_LUT4",
  59671. "parameters": {
  59672. "LUT_INIT": "0110100110010110"
  59673. },
  59674. "attributes": {
  59675. "module_not_derived": "00000000000000000000000000000001",
  59676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59677. },
  59678. "port_directions": {
  59679. "I0": "input",
  59680. "I1": "input",
  59681. "I2": "input",
  59682. "I3": "input",
  59683. "O": "output"
  59684. },
  59685. "connections": {
  59686. "I0": [ "0" ],
  59687. "I1": [ "0" ],
  59688. "I2": [ 2676 ],
  59689. "I3": [ 2677 ],
  59690. "O": [ 2678 ]
  59691. }
  59692. },
  59693. "cpu_I._zz_269__SB_LUT4_O_23_I2_SB_LUT4_O": {
  59694. "hide_name": 0,
  59695. "type": "SB_LUT4",
  59696. "parameters": {
  59697. "LUT_INIT": "0100011110111000"
  59698. },
  59699. "attributes": {
  59700. "module_not_derived": "00000000000000000000000000000001",
  59701. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59702. },
  59703. "port_directions": {
  59704. "I0": "input",
  59705. "I1": "input",
  59706. "I2": "input",
  59707. "I3": "input",
  59708. "O": "output"
  59709. },
  59710. "connections": {
  59711. "I0": [ 2679 ],
  59712. "I1": [ 2602 ],
  59713. "I2": [ 2680 ],
  59714. "I3": [ 2604 ],
  59715. "O": [ 2676 ]
  59716. }
  59717. },
  59718. "cpu_I._zz_269__SB_LUT4_O_23_I3_SB_CARRY_CO": {
  59719. "hide_name": 0,
  59720. "type": "SB_CARRY",
  59721. "parameters": {
  59722. },
  59723. "attributes": {
  59724. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59725. },
  59726. "port_directions": {
  59727. "CI": "input",
  59728. "CO": "output",
  59729. "I0": "input",
  59730. "I1": "input"
  59731. },
  59732. "connections": {
  59733. "CI": [ 2672 ],
  59734. "CO": [ 2677 ],
  59735. "I0": [ "0" ],
  59736. "I1": [ 2671 ]
  59737. }
  59738. },
  59739. "cpu_I._zz_269__SB_LUT4_O_24": {
  59740. "hide_name": 0,
  59741. "type": "SB_LUT4",
  59742. "parameters": {
  59743. "LUT_INIT": "0110100110010110"
  59744. },
  59745. "attributes": {
  59746. "module_not_derived": "00000000000000000000000000000001",
  59747. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59748. },
  59749. "port_directions": {
  59750. "I0": "input",
  59751. "I1": "input",
  59752. "I2": "input",
  59753. "I3": "input",
  59754. "O": "output"
  59755. },
  59756. "connections": {
  59757. "I0": [ "0" ],
  59758. "I1": [ "0" ],
  59759. "I2": [ 2681 ],
  59760. "I3": [ 2682 ],
  59761. "O": [ 2683 ]
  59762. }
  59763. },
  59764. "cpu_I._zz_269__SB_LUT4_O_24_I2_SB_LUT4_O": {
  59765. "hide_name": 0,
  59766. "type": "SB_LUT4",
  59767. "parameters": {
  59768. "LUT_INIT": "0010011111011000"
  59769. },
  59770. "attributes": {
  59771. "module_not_derived": "00000000000000000000000000000001",
  59772. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59773. },
  59774. "port_directions": {
  59775. "I0": "input",
  59776. "I1": "input",
  59777. "I2": "input",
  59778. "I3": "input",
  59779. "O": "output"
  59780. },
  59781. "connections": {
  59782. "I0": [ 2602 ],
  59783. "I1": [ 2684 ],
  59784. "I2": [ 2685 ],
  59785. "I3": [ 2604 ],
  59786. "O": [ 2681 ]
  59787. }
  59788. },
  59789. "cpu_I._zz_269__SB_LUT4_O_24_I3_SB_CARRY_CO": {
  59790. "hide_name": 0,
  59791. "type": "SB_CARRY",
  59792. "parameters": {
  59793. },
  59794. "attributes": {
  59795. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59796. },
  59797. "port_directions": {
  59798. "CI": "input",
  59799. "CO": "output",
  59800. "I0": "input",
  59801. "I1": "input"
  59802. },
  59803. "connections": {
  59804. "CI": [ 2665 ],
  59805. "CO": [ 2682 ],
  59806. "I0": [ "0" ],
  59807. "I1": [ 2664 ]
  59808. }
  59809. },
  59810. "cpu_I._zz_269__SB_LUT4_O_25": {
  59811. "hide_name": 0,
  59812. "type": "SB_LUT4",
  59813. "parameters": {
  59814. "LUT_INIT": "0110100110010110"
  59815. },
  59816. "attributes": {
  59817. "module_not_derived": "00000000000000000000000000000001",
  59818. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59819. },
  59820. "port_directions": {
  59821. "I0": "input",
  59822. "I1": "input",
  59823. "I2": "input",
  59824. "I3": "input",
  59825. "O": "output"
  59826. },
  59827. "connections": {
  59828. "I0": [ "0" ],
  59829. "I1": [ "0" ],
  59830. "I2": [ 2686 ],
  59831. "I3": [ 2687 ],
  59832. "O": [ 2688 ]
  59833. }
  59834. },
  59835. "cpu_I._zz_269__SB_LUT4_O_25_I2_SB_LUT4_O": {
  59836. "hide_name": 0,
  59837. "type": "SB_LUT4",
  59838. "parameters": {
  59839. "LUT_INIT": "0010011111011000"
  59840. },
  59841. "attributes": {
  59842. "module_not_derived": "00000000000000000000000000000001",
  59843. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59844. },
  59845. "port_directions": {
  59846. "I0": "input",
  59847. "I1": "input",
  59848. "I2": "input",
  59849. "I3": "input",
  59850. "O": "output"
  59851. },
  59852. "connections": {
  59853. "I0": [ 2602 ],
  59854. "I1": [ 2689 ],
  59855. "I2": [ 2690 ],
  59856. "I3": [ 2604 ],
  59857. "O": [ 2686 ]
  59858. }
  59859. },
  59860. "cpu_I._zz_269__SB_LUT4_O_25_I3_SB_CARRY_CO": {
  59861. "hide_name": 0,
  59862. "type": "SB_CARRY",
  59863. "parameters": {
  59864. },
  59865. "attributes": {
  59866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59867. },
  59868. "port_directions": {
  59869. "CI": "input",
  59870. "CO": "output",
  59871. "I0": "input",
  59872. "I1": "input"
  59873. },
  59874. "connections": {
  59875. "CI": [ 2682 ],
  59876. "CO": [ 2687 ],
  59877. "I0": [ "0" ],
  59878. "I1": [ 2681 ]
  59879. }
  59880. },
  59881. "cpu_I._zz_269__SB_LUT4_O_26": {
  59882. "hide_name": 0,
  59883. "type": "SB_LUT4",
  59884. "parameters": {
  59885. "LUT_INIT": "0110100110010110"
  59886. },
  59887. "attributes": {
  59888. "module_not_derived": "00000000000000000000000000000001",
  59889. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59890. },
  59891. "port_directions": {
  59892. "I0": "input",
  59893. "I1": "input",
  59894. "I2": "input",
  59895. "I3": "input",
  59896. "O": "output"
  59897. },
  59898. "connections": {
  59899. "I0": [ "0" ],
  59900. "I1": [ "0" ],
  59901. "I2": [ 2691 ],
  59902. "I3": [ 2692 ],
  59903. "O": [ 2693 ]
  59904. }
  59905. },
  59906. "cpu_I._zz_269__SB_LUT4_O_26_I2_SB_LUT4_O": {
  59907. "hide_name": 0,
  59908. "type": "SB_LUT4",
  59909. "parameters": {
  59910. "LUT_INIT": "0010011111011000"
  59911. },
  59912. "attributes": {
  59913. "module_not_derived": "00000000000000000000000000000001",
  59914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59915. },
  59916. "port_directions": {
  59917. "I0": "input",
  59918. "I1": "input",
  59919. "I2": "input",
  59920. "I3": "input",
  59921. "O": "output"
  59922. },
  59923. "connections": {
  59924. "I0": [ 2602 ],
  59925. "I1": [ 2694 ],
  59926. "I2": [ 2695 ],
  59927. "I3": [ 2604 ],
  59928. "O": [ 2691 ]
  59929. }
  59930. },
  59931. "cpu_I._zz_269__SB_LUT4_O_26_I3_SB_CARRY_CO": {
  59932. "hide_name": 0,
  59933. "type": "SB_CARRY",
  59934. "parameters": {
  59935. },
  59936. "attributes": {
  59937. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  59938. },
  59939. "port_directions": {
  59940. "CI": "input",
  59941. "CO": "output",
  59942. "I0": "input",
  59943. "I1": "input"
  59944. },
  59945. "connections": {
  59946. "CI": [ 2687 ],
  59947. "CO": [ 2692 ],
  59948. "I0": [ "0" ],
  59949. "I1": [ 2686 ]
  59950. }
  59951. },
  59952. "cpu_I._zz_269__SB_LUT4_O_27": {
  59953. "hide_name": 0,
  59954. "type": "SB_LUT4",
  59955. "parameters": {
  59956. "LUT_INIT": "0110100110010110"
  59957. },
  59958. "attributes": {
  59959. "module_not_derived": "00000000000000000000000000000001",
  59960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59961. },
  59962. "port_directions": {
  59963. "I0": "input",
  59964. "I1": "input",
  59965. "I2": "input",
  59966. "I3": "input",
  59967. "O": "output"
  59968. },
  59969. "connections": {
  59970. "I0": [ "0" ],
  59971. "I1": [ "0" ],
  59972. "I2": [ 2696 ],
  59973. "I3": [ 2697 ],
  59974. "O": [ 2698 ]
  59975. }
  59976. },
  59977. "cpu_I._zz_269__SB_LUT4_O_27_I2_SB_LUT4_O": {
  59978. "hide_name": 0,
  59979. "type": "SB_LUT4",
  59980. "parameters": {
  59981. "LUT_INIT": "0010011111011000"
  59982. },
  59983. "attributes": {
  59984. "module_not_derived": "00000000000000000000000000000001",
  59985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  59986. },
  59987. "port_directions": {
  59988. "I0": "input",
  59989. "I1": "input",
  59990. "I2": "input",
  59991. "I3": "input",
  59992. "O": "output"
  59993. },
  59994. "connections": {
  59995. "I0": [ 2602 ],
  59996. "I1": [ 2699 ],
  59997. "I2": [ 2700 ],
  59998. "I3": [ 2604 ],
  59999. "O": [ 2696 ]
  60000. }
  60001. },
  60002. "cpu_I._zz_269__SB_LUT4_O_27_I3_SB_CARRY_CO": {
  60003. "hide_name": 0,
  60004. "type": "SB_CARRY",
  60005. "parameters": {
  60006. },
  60007. "attributes": {
  60008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60009. },
  60010. "port_directions": {
  60011. "CI": "input",
  60012. "CO": "output",
  60013. "I0": "input",
  60014. "I1": "input"
  60015. },
  60016. "connections": {
  60017. "CI": [ 2692 ],
  60018. "CO": [ 2697 ],
  60019. "I0": [ "0" ],
  60020. "I1": [ 2691 ]
  60021. }
  60022. },
  60023. "cpu_I._zz_269__SB_LUT4_O_28": {
  60024. "hide_name": 0,
  60025. "type": "SB_LUT4",
  60026. "parameters": {
  60027. "LUT_INIT": "0110100110010110"
  60028. },
  60029. "attributes": {
  60030. "module_not_derived": "00000000000000000000000000000001",
  60031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60032. },
  60033. "port_directions": {
  60034. "I0": "input",
  60035. "I1": "input",
  60036. "I2": "input",
  60037. "I3": "input",
  60038. "O": "output"
  60039. },
  60040. "connections": {
  60041. "I0": [ "0" ],
  60042. "I1": [ "0" ],
  60043. "I2": [ 2701 ],
  60044. "I3": [ 2702 ],
  60045. "O": [ 2703 ]
  60046. }
  60047. },
  60048. "cpu_I._zz_269__SB_LUT4_O_28_I2_SB_LUT4_O": {
  60049. "hide_name": 0,
  60050. "type": "SB_LUT4",
  60051. "parameters": {
  60052. "LUT_INIT": "0010011111011000"
  60053. },
  60054. "attributes": {
  60055. "module_not_derived": "00000000000000000000000000000001",
  60056. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60057. },
  60058. "port_directions": {
  60059. "I0": "input",
  60060. "I1": "input",
  60061. "I2": "input",
  60062. "I3": "input",
  60063. "O": "output"
  60064. },
  60065. "connections": {
  60066. "I0": [ 2602 ],
  60067. "I1": [ 2704 ],
  60068. "I2": [ 2705 ],
  60069. "I3": [ 2604 ],
  60070. "O": [ 2701 ]
  60071. }
  60072. },
  60073. "cpu_I._zz_269__SB_LUT4_O_28_I3_SB_CARRY_CO": {
  60074. "hide_name": 0,
  60075. "type": "SB_CARRY",
  60076. "parameters": {
  60077. },
  60078. "attributes": {
  60079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60080. },
  60081. "port_directions": {
  60082. "CI": "input",
  60083. "CO": "output",
  60084. "I0": "input",
  60085. "I1": "input"
  60086. },
  60087. "connections": {
  60088. "CI": [ 2697 ],
  60089. "CO": [ 2702 ],
  60090. "I0": [ "0" ],
  60091. "I1": [ 2696 ]
  60092. }
  60093. },
  60094. "cpu_I._zz_269__SB_LUT4_O_29": {
  60095. "hide_name": 0,
  60096. "type": "SB_LUT4",
  60097. "parameters": {
  60098. "LUT_INIT": "0110100110010110"
  60099. },
  60100. "attributes": {
  60101. "module_not_derived": "00000000000000000000000000000001",
  60102. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60103. },
  60104. "port_directions": {
  60105. "I0": "input",
  60106. "I1": "input",
  60107. "I2": "input",
  60108. "I3": "input",
  60109. "O": "output"
  60110. },
  60111. "connections": {
  60112. "I0": [ "0" ],
  60113. "I1": [ "0" ],
  60114. "I2": [ 2706 ],
  60115. "I3": [ 2707 ],
  60116. "O": [ 2708 ]
  60117. }
  60118. },
  60119. "cpu_I._zz_269__SB_LUT4_O_29_I2_SB_LUT4_O": {
  60120. "hide_name": 0,
  60121. "type": "SB_LUT4",
  60122. "parameters": {
  60123. "LUT_INIT": "0010011111011000"
  60124. },
  60125. "attributes": {
  60126. "module_not_derived": "00000000000000000000000000000001",
  60127. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60128. },
  60129. "port_directions": {
  60130. "I0": "input",
  60131. "I1": "input",
  60132. "I2": "input",
  60133. "I3": "input",
  60134. "O": "output"
  60135. },
  60136. "connections": {
  60137. "I0": [ 2602 ],
  60138. "I1": [ 2709 ],
  60139. "I2": [ 2710 ],
  60140. "I3": [ 2604 ],
  60141. "O": [ 2706 ]
  60142. }
  60143. },
  60144. "cpu_I._zz_269__SB_LUT4_O_29_I3_SB_CARRY_CO": {
  60145. "hide_name": 0,
  60146. "type": "SB_CARRY",
  60147. "parameters": {
  60148. },
  60149. "attributes": {
  60150. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60151. },
  60152. "port_directions": {
  60153. "CI": "input",
  60154. "CO": "output",
  60155. "I0": "input",
  60156. "I1": "input"
  60157. },
  60158. "connections": {
  60159. "CI": [ 2702 ],
  60160. "CO": [ 2707 ],
  60161. "I0": [ "0" ],
  60162. "I1": [ 2701 ]
  60163. }
  60164. },
  60165. "cpu_I._zz_269__SB_LUT4_O_2_I2_SB_LUT4_O": {
  60166. "hide_name": 0,
  60167. "type": "SB_LUT4",
  60168. "parameters": {
  60169. "LUT_INIT": "0010011111011000"
  60170. },
  60171. "attributes": {
  60172. "module_not_derived": "00000000000000000000000000000001",
  60173. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60174. },
  60175. "port_directions": {
  60176. "I0": "input",
  60177. "I1": "input",
  60178. "I2": "input",
  60179. "I3": "input",
  60180. "O": "output"
  60181. },
  60182. "connections": {
  60183. "I0": [ 2602 ],
  60184. "I1": [ 2711 ],
  60185. "I2": [ 2712 ],
  60186. "I3": [ 2604 ],
  60187. "O": [ 2656 ]
  60188. }
  60189. },
  60190. "cpu_I._zz_269__SB_LUT4_O_2_I3_SB_CARRY_CO": {
  60191. "hide_name": 0,
  60192. "type": "SB_CARRY",
  60193. "parameters": {
  60194. },
  60195. "attributes": {
  60196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60197. },
  60198. "port_directions": {
  60199. "CI": "input",
  60200. "CO": "output",
  60201. "I0": "input",
  60202. "I1": "input"
  60203. },
  60204. "connections": {
  60205. "CI": [ 2596 ],
  60206. "CO": [ 2657 ],
  60207. "I0": [ "0" ],
  60208. "I1": [ 2595 ]
  60209. }
  60210. },
  60211. "cpu_I._zz_269__SB_LUT4_O_3": {
  60212. "hide_name": 0,
  60213. "type": "SB_LUT4",
  60214. "parameters": {
  60215. "LUT_INIT": "0110100110010110"
  60216. },
  60217. "attributes": {
  60218. "module_not_derived": "00000000000000000000000000000001",
  60219. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60220. },
  60221. "port_directions": {
  60222. "I0": "input",
  60223. "I1": "input",
  60224. "I2": "input",
  60225. "I3": "input",
  60226. "O": "output"
  60227. },
  60228. "connections": {
  60229. "I0": [ "0" ],
  60230. "I1": [ "0" ],
  60231. "I2": [ 2713 ],
  60232. "I3": [ 2714 ],
  60233. "O": [ 2715 ]
  60234. }
  60235. },
  60236. "cpu_I._zz_269__SB_LUT4_O_30": {
  60237. "hide_name": 0,
  60238. "type": "SB_LUT4",
  60239. "parameters": {
  60240. "LUT_INIT": "0110100110010110"
  60241. },
  60242. "attributes": {
  60243. "module_not_derived": "00000000000000000000000000000001",
  60244. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60245. },
  60246. "port_directions": {
  60247. "I0": "input",
  60248. "I1": "input",
  60249. "I2": "input",
  60250. "I3": "input",
  60251. "O": "output"
  60252. },
  60253. "connections": {
  60254. "I0": [ "0" ],
  60255. "I1": [ "0" ],
  60256. "I2": [ 2655 ],
  60257. "I3": [ 2654 ],
  60258. "O": [ 2716 ]
  60259. }
  60260. },
  60261. "cpu_I._zz_269__SB_LUT4_O_30_I2_SB_LUT4_O": {
  60262. "hide_name": 0,
  60263. "type": "SB_LUT4",
  60264. "parameters": {
  60265. "LUT_INIT": "0010011111011000"
  60266. },
  60267. "attributes": {
  60268. "module_not_derived": "00000000000000000000000000000001",
  60269. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60270. },
  60271. "port_directions": {
  60272. "I0": "input",
  60273. "I1": "input",
  60274. "I2": "input",
  60275. "I3": "input",
  60276. "O": "output"
  60277. },
  60278. "connections": {
  60279. "I0": [ 2602 ],
  60280. "I1": [ 2717 ],
  60281. "I2": [ 2718 ],
  60282. "I3": [ 2604 ],
  60283. "O": [ 2655 ]
  60284. }
  60285. },
  60286. "cpu_I._zz_269__SB_LUT4_O_30_I3_SB_CARRY_CO": {
  60287. "hide_name": 0,
  60288. "type": "SB_CARRY",
  60289. "parameters": {
  60290. },
  60291. "attributes": {
  60292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60293. },
  60294. "port_directions": {
  60295. "CI": "input",
  60296. "CO": "output",
  60297. "I0": "input",
  60298. "I1": "input"
  60299. },
  60300. "connections": {
  60301. "CI": [ 2707 ],
  60302. "CO": [ 2654 ],
  60303. "I0": [ "0" ],
  60304. "I1": [ 2706 ]
  60305. }
  60306. },
  60307. "cpu_I._zz_269__SB_LUT4_O_31": {
  60308. "hide_name": 0,
  60309. "type": "SB_LUT4",
  60310. "parameters": {
  60311. "LUT_INIT": "1111001111000000"
  60312. },
  60313. "attributes": {
  60314. "module_not_derived": "00000000000000000000000000000001",
  60315. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  60316. },
  60317. "port_directions": {
  60318. "I0": "input",
  60319. "I1": "input",
  60320. "I2": "input",
  60321. "I3": "input",
  60322. "O": "output"
  60323. },
  60324. "connections": {
  60325. "I0": [ "0" ],
  60326. "I1": [ 2602 ],
  60327. "I2": [ 2719 ],
  60328. "I3": [ 2720 ],
  60329. "O": [ 2670 ]
  60330. }
  60331. },
  60332. "cpu_I._zz_269__SB_LUT4_O_3_I2_SB_LUT4_O": {
  60333. "hide_name": 0,
  60334. "type": "SB_LUT4",
  60335. "parameters": {
  60336. "LUT_INIT": "0010011111011000"
  60337. },
  60338. "attributes": {
  60339. "module_not_derived": "00000000000000000000000000000001",
  60340. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60341. },
  60342. "port_directions": {
  60343. "I0": "input",
  60344. "I1": "input",
  60345. "I2": "input",
  60346. "I3": "input",
  60347. "O": "output"
  60348. },
  60349. "connections": {
  60350. "I0": [ 2602 ],
  60351. "I1": [ 2721 ],
  60352. "I2": [ 2722 ],
  60353. "I3": [ 2604 ],
  60354. "O": [ 2713 ]
  60355. }
  60356. },
  60357. "cpu_I._zz_269__SB_LUT4_O_3_I3_SB_CARRY_CO": {
  60358. "hide_name": 0,
  60359. "type": "SB_CARRY",
  60360. "parameters": {
  60361. },
  60362. "attributes": {
  60363. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60364. },
  60365. "port_directions": {
  60366. "CI": "input",
  60367. "CO": "output",
  60368. "I0": "input",
  60369. "I1": "input"
  60370. },
  60371. "connections": {
  60372. "CI": [ 2657 ],
  60373. "CO": [ 2714 ],
  60374. "I0": [ "0" ],
  60375. "I1": [ 2656 ]
  60376. }
  60377. },
  60378. "cpu_I._zz_269__SB_LUT4_O_4": {
  60379. "hide_name": 0,
  60380. "type": "SB_LUT4",
  60381. "parameters": {
  60382. "LUT_INIT": "0110100110010110"
  60383. },
  60384. "attributes": {
  60385. "module_not_derived": "00000000000000000000000000000001",
  60386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60387. },
  60388. "port_directions": {
  60389. "I0": "input",
  60390. "I1": "input",
  60391. "I2": "input",
  60392. "I3": "input",
  60393. "O": "output"
  60394. },
  60395. "connections": {
  60396. "I0": [ "0" ],
  60397. "I1": [ "0" ],
  60398. "I2": [ 2723 ],
  60399. "I3": [ 2724 ],
  60400. "O": [ 2725 ]
  60401. }
  60402. },
  60403. "cpu_I._zz_269__SB_LUT4_O_4_I2_SB_LUT4_O": {
  60404. "hide_name": 0,
  60405. "type": "SB_LUT4",
  60406. "parameters": {
  60407. "LUT_INIT": "0010011111011000"
  60408. },
  60409. "attributes": {
  60410. "module_not_derived": "00000000000000000000000000000001",
  60411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60412. },
  60413. "port_directions": {
  60414. "I0": "input",
  60415. "I1": "input",
  60416. "I2": "input",
  60417. "I3": "input",
  60418. "O": "output"
  60419. },
  60420. "connections": {
  60421. "I0": [ 2602 ],
  60422. "I1": [ 2726 ],
  60423. "I2": [ 2727 ],
  60424. "I3": [ 2604 ],
  60425. "O": [ 2723 ]
  60426. }
  60427. },
  60428. "cpu_I._zz_269__SB_LUT4_O_4_I3_SB_CARRY_CO": {
  60429. "hide_name": 0,
  60430. "type": "SB_CARRY",
  60431. "parameters": {
  60432. },
  60433. "attributes": {
  60434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60435. },
  60436. "port_directions": {
  60437. "CI": "input",
  60438. "CO": "output",
  60439. "I0": "input",
  60440. "I1": "input"
  60441. },
  60442. "connections": {
  60443. "CI": [ 2714 ],
  60444. "CO": [ 2724 ],
  60445. "I0": [ "0" ],
  60446. "I1": [ 2713 ]
  60447. }
  60448. },
  60449. "cpu_I._zz_269__SB_LUT4_O_5": {
  60450. "hide_name": 0,
  60451. "type": "SB_LUT4",
  60452. "parameters": {
  60453. "LUT_INIT": "0110100110010110"
  60454. },
  60455. "attributes": {
  60456. "module_not_derived": "00000000000000000000000000000001",
  60457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60458. },
  60459. "port_directions": {
  60460. "I0": "input",
  60461. "I1": "input",
  60462. "I2": "input",
  60463. "I3": "input",
  60464. "O": "output"
  60465. },
  60466. "connections": {
  60467. "I0": [ "0" ],
  60468. "I1": [ "0" ],
  60469. "I2": [ 2728 ],
  60470. "I3": [ 2729 ],
  60471. "O": [ 2730 ]
  60472. }
  60473. },
  60474. "cpu_I._zz_269__SB_LUT4_O_5_I2_SB_LUT4_O": {
  60475. "hide_name": 0,
  60476. "type": "SB_LUT4",
  60477. "parameters": {
  60478. "LUT_INIT": "0100011110111000"
  60479. },
  60480. "attributes": {
  60481. "module_not_derived": "00000000000000000000000000000001",
  60482. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60483. },
  60484. "port_directions": {
  60485. "I0": "input",
  60486. "I1": "input",
  60487. "I2": "input",
  60488. "I3": "input",
  60489. "O": "output"
  60490. },
  60491. "connections": {
  60492. "I0": [ 2731 ],
  60493. "I1": [ 2602 ],
  60494. "I2": [ 2732 ],
  60495. "I3": [ 2604 ],
  60496. "O": [ 2728 ]
  60497. }
  60498. },
  60499. "cpu_I._zz_269__SB_LUT4_O_5_I3_SB_CARRY_CO": {
  60500. "hide_name": 0,
  60501. "type": "SB_CARRY",
  60502. "parameters": {
  60503. },
  60504. "attributes": {
  60505. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60506. },
  60507. "port_directions": {
  60508. "CI": "input",
  60509. "CO": "output",
  60510. "I0": "input",
  60511. "I1": "input"
  60512. },
  60513. "connections": {
  60514. "CI": [ 2724 ],
  60515. "CO": [ 2729 ],
  60516. "I0": [ "0" ],
  60517. "I1": [ 2723 ]
  60518. }
  60519. },
  60520. "cpu_I._zz_269__SB_LUT4_O_6": {
  60521. "hide_name": 0,
  60522. "type": "SB_LUT4",
  60523. "parameters": {
  60524. "LUT_INIT": "0110100110010110"
  60525. },
  60526. "attributes": {
  60527. "module_not_derived": "00000000000000000000000000000001",
  60528. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60529. },
  60530. "port_directions": {
  60531. "I0": "input",
  60532. "I1": "input",
  60533. "I2": "input",
  60534. "I3": "input",
  60535. "O": "output"
  60536. },
  60537. "connections": {
  60538. "I0": [ "0" ],
  60539. "I1": [ "0" ],
  60540. "I2": [ 2733 ],
  60541. "I3": [ 2734 ],
  60542. "O": [ 2735 ]
  60543. }
  60544. },
  60545. "cpu_I._zz_269__SB_LUT4_O_6_I2_SB_LUT4_O": {
  60546. "hide_name": 0,
  60547. "type": "SB_LUT4",
  60548. "parameters": {
  60549. "LUT_INIT": "0100011110111000"
  60550. },
  60551. "attributes": {
  60552. "module_not_derived": "00000000000000000000000000000001",
  60553. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60554. },
  60555. "port_directions": {
  60556. "I0": "input",
  60557. "I1": "input",
  60558. "I2": "input",
  60559. "I3": "input",
  60560. "O": "output"
  60561. },
  60562. "connections": {
  60563. "I0": [ 2736 ],
  60564. "I1": [ 2602 ],
  60565. "I2": [ 2737 ],
  60566. "I3": [ 2604 ],
  60567. "O": [ 2733 ]
  60568. }
  60569. },
  60570. "cpu_I._zz_269__SB_LUT4_O_6_I3_SB_CARRY_CO": {
  60571. "hide_name": 0,
  60572. "type": "SB_CARRY",
  60573. "parameters": {
  60574. },
  60575. "attributes": {
  60576. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60577. },
  60578. "port_directions": {
  60579. "CI": "input",
  60580. "CO": "output",
  60581. "I0": "input",
  60582. "I1": "input"
  60583. },
  60584. "connections": {
  60585. "CI": [ 2729 ],
  60586. "CO": [ 2734 ],
  60587. "I0": [ "0" ],
  60588. "I1": [ 2728 ]
  60589. }
  60590. },
  60591. "cpu_I._zz_269__SB_LUT4_O_7": {
  60592. "hide_name": 0,
  60593. "type": "SB_LUT4",
  60594. "parameters": {
  60595. "LUT_INIT": "0110100110010110"
  60596. },
  60597. "attributes": {
  60598. "module_not_derived": "00000000000000000000000000000001",
  60599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60600. },
  60601. "port_directions": {
  60602. "I0": "input",
  60603. "I1": "input",
  60604. "I2": "input",
  60605. "I3": "input",
  60606. "O": "output"
  60607. },
  60608. "connections": {
  60609. "I0": [ "0" ],
  60610. "I1": [ "0" ],
  60611. "I2": [ 2738 ],
  60612. "I3": [ 2739 ],
  60613. "O": [ 2740 ]
  60614. }
  60615. },
  60616. "cpu_I._zz_269__SB_LUT4_O_7_I2_SB_LUT4_O": {
  60617. "hide_name": 0,
  60618. "type": "SB_LUT4",
  60619. "parameters": {
  60620. "LUT_INIT": "0100011110111000"
  60621. },
  60622. "attributes": {
  60623. "module_not_derived": "00000000000000000000000000000001",
  60624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60625. },
  60626. "port_directions": {
  60627. "I0": "input",
  60628. "I1": "input",
  60629. "I2": "input",
  60630. "I3": "input",
  60631. "O": "output"
  60632. },
  60633. "connections": {
  60634. "I0": [ 2741 ],
  60635. "I1": [ 2602 ],
  60636. "I2": [ 2742 ],
  60637. "I3": [ 2604 ],
  60638. "O": [ 2738 ]
  60639. }
  60640. },
  60641. "cpu_I._zz_269__SB_LUT4_O_7_I3_SB_CARRY_CO": {
  60642. "hide_name": 0,
  60643. "type": "SB_CARRY",
  60644. "parameters": {
  60645. },
  60646. "attributes": {
  60647. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60648. },
  60649. "port_directions": {
  60650. "CI": "input",
  60651. "CO": "output",
  60652. "I0": "input",
  60653. "I1": "input"
  60654. },
  60655. "connections": {
  60656. "CI": [ 2734 ],
  60657. "CO": [ 2739 ],
  60658. "I0": [ "0" ],
  60659. "I1": [ 2733 ]
  60660. }
  60661. },
  60662. "cpu_I._zz_269__SB_LUT4_O_8": {
  60663. "hide_name": 0,
  60664. "type": "SB_LUT4",
  60665. "parameters": {
  60666. "LUT_INIT": "0110100110010110"
  60667. },
  60668. "attributes": {
  60669. "module_not_derived": "00000000000000000000000000000001",
  60670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60671. },
  60672. "port_directions": {
  60673. "I0": "input",
  60674. "I1": "input",
  60675. "I2": "input",
  60676. "I3": "input",
  60677. "O": "output"
  60678. },
  60679. "connections": {
  60680. "I0": [ "0" ],
  60681. "I1": [ "0" ],
  60682. "I2": [ 2743 ],
  60683. "I3": [ 2744 ],
  60684. "O": [ 2745 ]
  60685. }
  60686. },
  60687. "cpu_I._zz_269__SB_LUT4_O_8_I2_SB_LUT4_O": {
  60688. "hide_name": 0,
  60689. "type": "SB_LUT4",
  60690. "parameters": {
  60691. "LUT_INIT": "0100011110111000"
  60692. },
  60693. "attributes": {
  60694. "module_not_derived": "00000000000000000000000000000001",
  60695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60696. },
  60697. "port_directions": {
  60698. "I0": "input",
  60699. "I1": "input",
  60700. "I2": "input",
  60701. "I3": "input",
  60702. "O": "output"
  60703. },
  60704. "connections": {
  60705. "I0": [ 2746 ],
  60706. "I1": [ 2602 ],
  60707. "I2": [ 2747 ],
  60708. "I3": [ 2604 ],
  60709. "O": [ 2743 ]
  60710. }
  60711. },
  60712. "cpu_I._zz_269__SB_LUT4_O_8_I3_SB_CARRY_CO": {
  60713. "hide_name": 0,
  60714. "type": "SB_CARRY",
  60715. "parameters": {
  60716. },
  60717. "attributes": {
  60718. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60719. },
  60720. "port_directions": {
  60721. "CI": "input",
  60722. "CO": "output",
  60723. "I0": "input",
  60724. "I1": "input"
  60725. },
  60726. "connections": {
  60727. "CI": [ 2739 ],
  60728. "CO": [ 2744 ],
  60729. "I0": [ "0" ],
  60730. "I1": [ 2738 ]
  60731. }
  60732. },
  60733. "cpu_I._zz_269__SB_LUT4_O_9": {
  60734. "hide_name": 0,
  60735. "type": "SB_LUT4",
  60736. "parameters": {
  60737. "LUT_INIT": "0110100110010110"
  60738. },
  60739. "attributes": {
  60740. "module_not_derived": "00000000000000000000000000000001",
  60741. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60742. },
  60743. "port_directions": {
  60744. "I0": "input",
  60745. "I1": "input",
  60746. "I2": "input",
  60747. "I3": "input",
  60748. "O": "output"
  60749. },
  60750. "connections": {
  60751. "I0": [ "0" ],
  60752. "I1": [ "0" ],
  60753. "I2": [ 2606 ],
  60754. "I3": [ 2605 ],
  60755. "O": [ 2748 ]
  60756. }
  60757. },
  60758. "cpu_I._zz_269__SB_LUT4_O_9_I2_SB_LUT4_O": {
  60759. "hide_name": 0,
  60760. "type": "SB_LUT4",
  60761. "parameters": {
  60762. "LUT_INIT": "0100011110111000"
  60763. },
  60764. "attributes": {
  60765. "module_not_derived": "00000000000000000000000000000001",
  60766. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60767. },
  60768. "port_directions": {
  60769. "I0": "input",
  60770. "I1": "input",
  60771. "I2": "input",
  60772. "I3": "input",
  60773. "O": "output"
  60774. },
  60775. "connections": {
  60776. "I0": [ 2749 ],
  60777. "I1": [ 2602 ],
  60778. "I2": [ 2750 ],
  60779. "I3": [ 2604 ],
  60780. "O": [ 2606 ]
  60781. }
  60782. },
  60783. "cpu_I._zz_269__SB_LUT4_O_9_I3_SB_CARRY_CO": {
  60784. "hide_name": 0,
  60785. "type": "SB_CARRY",
  60786. "parameters": {
  60787. },
  60788. "attributes": {
  60789. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60790. },
  60791. "port_directions": {
  60792. "CI": "input",
  60793. "CO": "output",
  60794. "I0": "input",
  60795. "I1": "input"
  60796. },
  60797. "connections": {
  60798. "CI": [ 2744 ],
  60799. "CO": [ 2605 ],
  60800. "I0": [ "0" ],
  60801. "I1": [ 2743 ]
  60802. }
  60803. },
  60804. "cpu_I._zz_269__SB_LUT4_O_I2_SB_LUT4_O": {
  60805. "hide_name": 0,
  60806. "type": "SB_LUT4",
  60807. "parameters": {
  60808. "LUT_INIT": "0100011110111000"
  60809. },
  60810. "attributes": {
  60811. "module_not_derived": "00000000000000000000000000000001",
  60812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60813. },
  60814. "port_directions": {
  60815. "I0": "input",
  60816. "I1": "input",
  60817. "I2": "input",
  60818. "I3": "input",
  60819. "O": "output"
  60820. },
  60821. "connections": {
  60822. "I0": [ 2751 ],
  60823. "I1": [ 2602 ],
  60824. "I2": [ 2752 ],
  60825. "I3": [ 2604 ],
  60826. "O": [ 2592 ]
  60827. }
  60828. },
  60829. "cpu_I._zz_269__SB_LUT4_O_I3_SB_CARRY_CO": {
  60830. "hide_name": 0,
  60831. "type": "SB_CARRY",
  60832. "parameters": {
  60833. },
  60834. "attributes": {
  60835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  60836. },
  60837. "port_directions": {
  60838. "CI": "input",
  60839. "CO": "output",
  60840. "I0": "input",
  60841. "I1": "input"
  60842. },
  60843. "connections": {
  60844. "CI": [ 2677 ],
  60845. "CO": [ 2593 ],
  60846. "I0": [ "0" ],
  60847. "I1": [ 2676 ]
  60848. }
  60849. },
  60850. "cpu_I._zz_278__SB_DFFER_D": {
  60851. "hide_name": 0,
  60852. "type": "SB_DFFER",
  60853. "parameters": {
  60854. },
  60855. "attributes": {
  60856. "module_not_derived": "00000000000000000000000000000001",
  60857. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  60858. },
  60859. "port_directions": {
  60860. "C": "input",
  60861. "D": "input",
  60862. "E": "input",
  60863. "Q": "output",
  60864. "R": "input"
  60865. },
  60866. "connections": {
  60867. "C": [ 42 ],
  60868. "D": [ 1223 ],
  60869. "E": [ 1040 ],
  60870. "Q": [ 2753 ],
  60871. "R": [ 127 ]
  60872. }
  60873. },
  60874. "cpu_I._zz_278__SB_DFFER_D_Q_SB_LUT4_I3": {
  60875. "hide_name": 0,
  60876. "type": "SB_LUT4",
  60877. "parameters": {
  60878. "LUT_INIT": "0001001101011111"
  60879. },
  60880. "attributes": {
  60881. "module_not_derived": "00000000000000000000000000000001",
  60882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60883. },
  60884. "port_directions": {
  60885. "I0": "input",
  60886. "I1": "input",
  60887. "I2": "input",
  60888. "I3": "input",
  60889. "O": "output"
  60890. },
  60891. "connections": {
  60892. "I0": [ 1107 ],
  60893. "I1": [ 1037 ],
  60894. "I2": [ 1043 ],
  60895. "I3": [ 2753 ],
  60896. "O": [ 2754 ]
  60897. }
  60898. },
  60899. "cpu_I._zz_278__SB_LUT4_O": {
  60900. "hide_name": 0,
  60901. "type": "SB_LUT4",
  60902. "parameters": {
  60903. "LUT_INIT": "0111000001111010"
  60904. },
  60905. "attributes": {
  60906. "module_not_derived": "00000000000000000000000000000001",
  60907. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60908. },
  60909. "port_directions": {
  60910. "I0": "input",
  60911. "I1": "input",
  60912. "I2": "input",
  60913. "I3": "input",
  60914. "O": "output"
  60915. },
  60916. "connections": {
  60917. "I0": [ 964 ],
  60918. "I1": [ 966 ],
  60919. "I2": [ 2474 ],
  60920. "I3": [ 2755 ],
  60921. "O": [ 1223 ]
  60922. }
  60923. },
  60924. "cpu_I._zz_278__SB_LUT4_O_I2_SB_LUT4_O": {
  60925. "hide_name": 0,
  60926. "type": "SB_LUT4",
  60927. "parameters": {
  60928. "LUT_INIT": "0000110000001010"
  60929. },
  60930. "attributes": {
  60931. "module_not_derived": "00000000000000000000000000000001",
  60932. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60933. },
  60934. "port_directions": {
  60935. "I0": "input",
  60936. "I1": "input",
  60937. "I2": "input",
  60938. "I3": "input",
  60939. "O": "output"
  60940. },
  60941. "connections": {
  60942. "I0": [ 2756 ],
  60943. "I1": [ 968 ],
  60944. "I2": [ 2757 ],
  60945. "I3": [ 2758 ],
  60946. "O": [ 2473 ]
  60947. }
  60948. },
  60949. "cpu_I._zz_278__SB_LUT4_O_I2_SB_LUT4_O_1": {
  60950. "hide_name": 0,
  60951. "type": "SB_LUT4",
  60952. "parameters": {
  60953. "LUT_INIT": "1010000011111100"
  60954. },
  60955. "attributes": {
  60956. "module_not_derived": "00000000000000000000000000000001",
  60957. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  60958. },
  60959. "port_directions": {
  60960. "I0": "input",
  60961. "I1": "input",
  60962. "I2": "input",
  60963. "I3": "input",
  60964. "O": "output"
  60965. },
  60966. "connections": {
  60967. "I0": [ 956 ],
  60968. "I1": [ 2759 ],
  60969. "I2": [ 2757 ],
  60970. "I3": [ 2758 ],
  60971. "O": [ 2474 ]
  60972. }
  60973. },
  60974. "cpu_I._zz_278__SB_LUT4_O_I3_SB_LUT4_O": {
  60975. "hide_name": 0,
  60976. "type": "SB_LUT4",
  60977. "parameters": {
  60978. "LUT_INIT": "0011111100000000"
  60979. },
  60980. "attributes": {
  60981. "module_not_derived": "00000000000000000000000000000001",
  60982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  60983. },
  60984. "port_directions": {
  60985. "I0": "input",
  60986. "I1": "input",
  60987. "I2": "input",
  60988. "I3": "input",
  60989. "O": "output"
  60990. },
  60991. "connections": {
  60992. "I0": [ "0" ],
  60993. "I1": [ 1173 ],
  60994. "I2": [ 1034 ],
  60995. "I3": [ 2754 ],
  60996. "O": [ 2755 ]
  60997. }
  60998. },
  60999. "cpu_I._zz_278__SB_LUT4_O_I3_SB_LUT4_O_1": {
  61000. "hide_name": 0,
  61001. "type": "SB_LUT4",
  61002. "parameters": {
  61003. "LUT_INIT": "0110010011111101"
  61004. },
  61005. "attributes": {
  61006. "module_not_derived": "00000000000000000000000000000001",
  61007. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61008. },
  61009. "port_directions": {
  61010. "I0": "input",
  61011. "I1": "input",
  61012. "I2": "input",
  61013. "I3": "input",
  61014. "O": "output"
  61015. },
  61016. "connections": {
  61017. "I0": [ 1246 ],
  61018. "I1": [ 1247 ],
  61019. "I2": [ 2760 ],
  61020. "I3": [ 2761 ],
  61021. "O": [ 2762 ]
  61022. }
  61023. },
  61024. "cpu_I._zz_278__SB_LUT4_O_I3_SB_LUT4_O_1_I2_SB_LUT4_O": {
  61025. "hide_name": 0,
  61026. "type": "SB_LUT4",
  61027. "parameters": {
  61028. "LUT_INIT": "0010111110010010"
  61029. },
  61030. "attributes": {
  61031. "module_not_derived": "00000000000000000000000000000001",
  61032. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61033. },
  61034. "port_directions": {
  61035. "I0": "input",
  61036. "I1": "input",
  61037. "I2": "input",
  61038. "I3": "input",
  61039. "O": "output"
  61040. },
  61041. "connections": {
  61042. "I0": [ 966 ],
  61043. "I1": [ 1250 ],
  61044. "I2": [ 2474 ],
  61045. "I3": [ 2362 ],
  61046. "O": [ 2760 ]
  61047. }
  61048. },
  61049. "cpu_I._zz_279__SB_DFFER_D": {
  61050. "hide_name": 0,
  61051. "type": "SB_DFFER",
  61052. "parameters": {
  61053. },
  61054. "attributes": {
  61055. "module_not_derived": "00000000000000000000000000000001",
  61056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  61057. },
  61058. "port_directions": {
  61059. "C": "input",
  61060. "D": "input",
  61061. "E": "input",
  61062. "Q": "output",
  61063. "R": "input"
  61064. },
  61065. "connections": {
  61066. "C": [ 42 ],
  61067. "D": [ 2763 ],
  61068. "E": [ 1040 ],
  61069. "Q": [ 2764 ],
  61070. "R": [ 127 ]
  61071. }
  61072. },
  61073. "cpu_I._zz_279__SB_DFFER_D_Q_SB_LUT4_O": {
  61074. "hide_name": 0,
  61075. "type": "SB_LUT4",
  61076. "parameters": {
  61077. "LUT_INIT": "0001010100111111"
  61078. },
  61079. "attributes": {
  61080. "module_not_derived": "00000000000000000000000000000001",
  61081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61082. },
  61083. "port_directions": {
  61084. "I0": "input",
  61085. "I1": "input",
  61086. "I2": "input",
  61087. "I3": "input",
  61088. "O": "output"
  61089. },
  61090. "connections": {
  61091. "I0": [ 1111 ],
  61092. "I1": [ 1175 ],
  61093. "I2": [ 1034 ],
  61094. "I3": [ 1043 ],
  61095. "O": [ 2765 ]
  61096. }
  61097. },
  61098. "cpu_I._zz_279__SB_LUT4_I2": {
  61099. "hide_name": 0,
  61100. "type": "SB_LUT4",
  61101. "parameters": {
  61102. "LUT_INIT": "1111001111000000"
  61103. },
  61104. "attributes": {
  61105. "module_not_derived": "00000000000000000000000000000001",
  61106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61107. },
  61108. "port_directions": {
  61109. "I0": "input",
  61110. "I1": "input",
  61111. "I2": "input",
  61112. "I3": "input",
  61113. "O": "output"
  61114. },
  61115. "connections": {
  61116. "I0": [ "0" ],
  61117. "I1": [ 2261 ],
  61118. "I2": [ 2763 ],
  61119. "I3": [ 2766 ],
  61120. "O": [ 2767 ]
  61121. }
  61122. },
  61123. "cpu_I._zz_279__SB_LUT4_I2_1": {
  61124. "hide_name": 0,
  61125. "type": "SB_LUT4",
  61126. "parameters": {
  61127. "LUT_INIT": "1110001011000000"
  61128. },
  61129. "attributes": {
  61130. "module_not_derived": "00000000000000000000000000000001",
  61131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61132. },
  61133. "port_directions": {
  61134. "I0": "input",
  61135. "I1": "input",
  61136. "I2": "input",
  61137. "I3": "input",
  61138. "O": "output"
  61139. },
  61140. "connections": {
  61141. "I0": [ 1111 ],
  61142. "I1": [ 2768 ],
  61143. "I2": [ 2763 ],
  61144. "I3": [ 1052 ],
  61145. "O": [ 1110 ]
  61146. }
  61147. },
  61148. "cpu_I._zz_279__SB_LUT4_I2_I3_SB_LUT4_O": {
  61149. "hide_name": 0,
  61150. "type": "SB_LUT4",
  61151. "parameters": {
  61152. "LUT_INIT": "0011000011110000"
  61153. },
  61154. "attributes": {
  61155. "module_not_derived": "00000000000000000000000000000001",
  61156. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61157. },
  61158. "port_directions": {
  61159. "I0": "input",
  61160. "I1": "input",
  61161. "I2": "input",
  61162. "I3": "input",
  61163. "O": "output"
  61164. },
  61165. "connections": {
  61166. "I0": [ "0" ],
  61167. "I1": [ 2260 ],
  61168. "I2": [ 2035 ],
  61169. "I3": [ 1475 ],
  61170. "O": [ 2766 ]
  61171. }
  61172. },
  61173. "cpu_I._zz_279__SB_LUT4_I2_O_SB_DFFR_D": {
  61174. "hide_name": 0,
  61175. "type": "SB_DFFR",
  61176. "parameters": {
  61177. },
  61178. "attributes": {
  61179. "module_not_derived": "00000000000000000000000000000001",
  61180. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  61181. },
  61182. "port_directions": {
  61183. "C": "input",
  61184. "D": "input",
  61185. "Q": "output",
  61186. "R": "input"
  61187. },
  61188. "connections": {
  61189. "C": [ 42 ],
  61190. "D": [ 2767 ],
  61191. "Q": [ 2035 ],
  61192. "R": [ 127 ]
  61193. }
  61194. },
  61195. "cpu_I._zz_279__SB_LUT4_O": {
  61196. "hide_name": 0,
  61197. "type": "SB_LUT4",
  61198. "parameters": {
  61199. "LUT_INIT": "0111000001111010"
  61200. },
  61201. "attributes": {
  61202. "module_not_derived": "00000000000000000000000000000001",
  61203. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61204. },
  61205. "port_directions": {
  61206. "I0": "input",
  61207. "I1": "input",
  61208. "I2": "input",
  61209. "I3": "input",
  61210. "O": "output"
  61211. },
  61212. "connections": {
  61213. "I0": [ 964 ],
  61214. "I1": [ 966 ],
  61215. "I2": [ 2470 ],
  61216. "I3": [ 2769 ],
  61217. "O": [ 2763 ]
  61218. }
  61219. },
  61220. "cpu_I._zz_279__SB_LUT4_O_I2_SB_LUT4_O": {
  61221. "hide_name": 0,
  61222. "type": "SB_LUT4",
  61223. "parameters": {
  61224. "LUT_INIT": "1010000000001100"
  61225. },
  61226. "attributes": {
  61227. "module_not_derived": "00000000000000000000000000000001",
  61228. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61229. },
  61230. "port_directions": {
  61231. "I0": "input",
  61232. "I1": "input",
  61233. "I2": "input",
  61234. "I3": "input",
  61235. "O": "output"
  61236. },
  61237. "connections": {
  61238. "I0": [ 958 ],
  61239. "I1": [ 2770 ],
  61240. "I2": [ 2757 ],
  61241. "I3": [ 2758 ],
  61242. "O": [ 2470 ]
  61243. }
  61244. },
  61245. "cpu_I._zz_279__SB_LUT4_O_I2_SB_LUT4_O_1": {
  61246. "hide_name": 0,
  61247. "type": "SB_LUT4",
  61248. "parameters": {
  61249. "LUT_INIT": "0000101000001100"
  61250. },
  61251. "attributes": {
  61252. "module_not_derived": "00000000000000000000000000000001",
  61253. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61254. },
  61255. "port_directions": {
  61256. "I0": "input",
  61257. "I1": "input",
  61258. "I2": "input",
  61259. "I3": "input",
  61260. "O": "output"
  61261. },
  61262. "connections": {
  61263. "I0": [ 946 ],
  61264. "I1": [ 2771 ],
  61265. "I2": [ 2757 ],
  61266. "I3": [ 2758 ],
  61267. "O": [ 2469 ]
  61268. }
  61269. },
  61270. "cpu_I._zz_280__SB_DFFER_D": {
  61271. "hide_name": 0,
  61272. "type": "SB_DFFER",
  61273. "parameters": {
  61274. },
  61275. "attributes": {
  61276. "module_not_derived": "00000000000000000000000000000001",
  61277. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  61278. },
  61279. "port_directions": {
  61280. "C": "input",
  61281. "D": "input",
  61282. "E": "input",
  61283. "Q": "output",
  61284. "R": "input"
  61285. },
  61286. "connections": {
  61287. "C": [ 42 ],
  61288. "D": [ 2262 ],
  61289. "E": [ 1040 ],
  61290. "Q": [ 2772 ],
  61291. "R": [ 127 ]
  61292. }
  61293. },
  61294. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_I2": {
  61295. "hide_name": 0,
  61296. "type": "SB_LUT4",
  61297. "parameters": {
  61298. "LUT_INIT": "0001001100000000"
  61299. },
  61300. "attributes": {
  61301. "module_not_derived": "00000000000000000000000000000001",
  61302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61303. },
  61304. "port_directions": {
  61305. "I0": "input",
  61306. "I1": "input",
  61307. "I2": "input",
  61308. "I3": "input",
  61309. "O": "output"
  61310. },
  61311. "connections": {
  61312. "I0": [ 1037 ],
  61313. "I1": [ 1029 ],
  61314. "I2": [ 2772 ],
  61315. "I3": [ 2773 ],
  61316. "O": [ 2774 ]
  61317. }
  61318. },
  61319. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_I2_O_SB_LUT4_O": {
  61320. "hide_name": 0,
  61321. "type": "SB_LUT4",
  61322. "parameters": {
  61323. "LUT_INIT": "0110111101001101"
  61324. },
  61325. "attributes": {
  61326. "module_not_derived": "00000000000000000000000000000001",
  61327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61328. },
  61329. "port_directions": {
  61330. "I0": "input",
  61331. "I1": "input",
  61332. "I2": "input",
  61333. "I3": "input",
  61334. "O": "output"
  61335. },
  61336. "connections": {
  61337. "I0": [ 1246 ],
  61338. "I1": [ 1247 ],
  61339. "I2": [ 2775 ],
  61340. "I3": [ 2776 ],
  61341. "O": [ 2777 ]
  61342. }
  61343. },
  61344. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_I2_O_SB_LUT4_O_1": {
  61345. "hide_name": 0,
  61346. "type": "SB_LUT4",
  61347. "parameters": {
  61348. "LUT_INIT": "0000000000000100"
  61349. },
  61350. "attributes": {
  61351. "module_not_derived": "00000000000000000000000000000001",
  61352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61353. },
  61354. "port_directions": {
  61355. "I0": "input",
  61356. "I1": "input",
  61357. "I2": "input",
  61358. "I3": "input",
  61359. "O": "output"
  61360. },
  61361. "connections": {
  61362. "I0": [ 1246 ],
  61363. "I1": [ 1247 ],
  61364. "I2": [ 2778 ],
  61365. "I3": [ 2779 ],
  61366. "O": [ 2780 ]
  61367. }
  61368. },
  61369. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  61370. "hide_name": 0,
  61371. "type": "SB_LUT4",
  61372. "parameters": {
  61373. "LUT_INIT": "0000000001101111"
  61374. },
  61375. "attributes": {
  61376. "module_not_derived": "00000000000000000000000000000001",
  61377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61378. },
  61379. "port_directions": {
  61380. "I0": "input",
  61381. "I1": "input",
  61382. "I2": "input",
  61383. "I3": "input",
  61384. "O": "output"
  61385. },
  61386. "connections": {
  61387. "I0": [ 966 ],
  61388. "I1": [ 1250 ],
  61389. "I2": [ 2781 ],
  61390. "I3": [ 2782 ],
  61391. "O": [ 2776 ]
  61392. }
  61393. },
  61394. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_O": {
  61395. "hide_name": 0,
  61396. "type": "SB_LUT4",
  61397. "parameters": {
  61398. "LUT_INIT": "0001010100111111"
  61399. },
  61400. "attributes": {
  61401. "module_not_derived": "00000000000000000000000000000001",
  61402. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61403. },
  61404. "port_directions": {
  61405. "I0": "input",
  61406. "I1": "input",
  61407. "I2": "input",
  61408. "I3": "input",
  61409. "O": "output"
  61410. },
  61411. "connections": {
  61412. "I0": [ 1113 ],
  61413. "I1": [ 1034 ],
  61414. "I2": [ 1176 ],
  61415. "I3": [ 1043 ],
  61416. "O": [ 2773 ]
  61417. }
  61418. },
  61419. "cpu_I._zz_280__SB_LUT4_I2": {
  61420. "hide_name": 0,
  61421. "type": "SB_LUT4",
  61422. "parameters": {
  61423. "LUT_INIT": "1110001011000000"
  61424. },
  61425. "attributes": {
  61426. "module_not_derived": "00000000000000000000000000000001",
  61427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  61428. },
  61429. "port_directions": {
  61430. "I0": "input",
  61431. "I1": "input",
  61432. "I2": "input",
  61433. "I3": "input",
  61434. "O": "output"
  61435. },
  61436. "connections": {
  61437. "I0": [ 1113 ],
  61438. "I1": [ 2768 ],
  61439. "I2": [ 2262 ],
  61440. "I3": [ 1052 ],
  61441. "O": [ 1112 ]
  61442. }
  61443. },
  61444. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O": {
  61445. "hide_name": 0,
  61446. "type": "SB_LUT4",
  61447. "parameters": {
  61448. "LUT_INIT": "1100000011110011"
  61449. },
  61450. "attributes": {
  61451. "module_not_derived": "00000000000000000000000000000001",
  61452. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61453. },
  61454. "port_directions": {
  61455. "I0": "input",
  61456. "I1": "input",
  61457. "I2": "input",
  61458. "I3": "input",
  61459. "O": "output"
  61460. },
  61461. "connections": {
  61462. "I0": [ "0" ],
  61463. "I1": [ 2768 ],
  61464. "I2": [ 1223 ],
  61465. "I3": [ 2783 ],
  61466. "O": [ 1106 ]
  61467. }
  61468. },
  61469. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_1": {
  61470. "hide_name": 0,
  61471. "type": "SB_LUT4",
  61472. "parameters": {
  61473. "LUT_INIT": "1100111100000011"
  61474. },
  61475. "attributes": {
  61476. "module_not_derived": "00000000000000000000000000000001",
  61477. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61478. },
  61479. "port_directions": {
  61480. "I0": "input",
  61481. "I1": "input",
  61482. "I2": "input",
  61483. "I3": "input",
  61484. "O": "output"
  61485. },
  61486. "connections": {
  61487. "I0": [ "0" ],
  61488. "I1": [ 2768 ],
  61489. "I2": [ 2784 ],
  61490. "I3": [ 1039 ],
  61491. "O": [ 1105 ]
  61492. }
  61493. },
  61494. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_10": {
  61495. "hide_name": 0,
  61496. "type": "SB_LUT4",
  61497. "parameters": {
  61498. "LUT_INIT": "1100000011110011"
  61499. },
  61500. "attributes": {
  61501. "module_not_derived": "00000000000000000000000000000001",
  61502. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61503. },
  61504. "port_directions": {
  61505. "I0": "input",
  61506. "I1": "input",
  61507. "I2": "input",
  61508. "I3": "input",
  61509. "O": "output"
  61510. },
  61511. "connections": {
  61512. "I0": [ "0" ],
  61513. "I1": [ 2768 ],
  61514. "I2": [ 1146 ],
  61515. "I3": [ 2785 ],
  61516. "O": [ 1085 ]
  61517. }
  61518. },
  61519. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_LUT4_O": {
  61520. "hide_name": 0,
  61521. "type": "SB_LUT4",
  61522. "parameters": {
  61523. "LUT_INIT": "0000111100110011"
  61524. },
  61525. "attributes": {
  61526. "module_not_derived": "00000000000000000000000000000001",
  61527. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61528. },
  61529. "port_directions": {
  61530. "I0": "input",
  61531. "I1": "input",
  61532. "I2": "input",
  61533. "I3": "input",
  61534. "O": "output"
  61535. },
  61536. "connections": {
  61537. "I0": [ "0" ],
  61538. "I1": [ 2786 ],
  61539. "I2": [ 1086 ],
  61540. "I3": [ 1052 ],
  61541. "O": [ 2785 ]
  61542. }
  61543. },
  61544. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_11": {
  61545. "hide_name": 0,
  61546. "type": "SB_LUT4",
  61547. "parameters": {
  61548. "LUT_INIT": "1100000011110011"
  61549. },
  61550. "attributes": {
  61551. "module_not_derived": "00000000000000000000000000000001",
  61552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61553. },
  61554. "port_directions": {
  61555. "I0": "input",
  61556. "I1": "input",
  61557. "I2": "input",
  61558. "I3": "input",
  61559. "O": "output"
  61560. },
  61561. "connections": {
  61562. "I0": [ "0" ],
  61563. "I1": [ 2768 ],
  61564. "I2": [ 1203 ],
  61565. "I3": [ 2787 ],
  61566. "O": [ 1083 ]
  61567. }
  61568. },
  61569. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_LUT4_O": {
  61570. "hide_name": 0,
  61571. "type": "SB_LUT4",
  61572. "parameters": {
  61573. "LUT_INIT": "0000111100110011"
  61574. },
  61575. "attributes": {
  61576. "module_not_derived": "00000000000000000000000000000001",
  61577. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61578. },
  61579. "port_directions": {
  61580. "I0": "input",
  61581. "I1": "input",
  61582. "I2": "input",
  61583. "I3": "input",
  61584. "O": "output"
  61585. },
  61586. "connections": {
  61587. "I0": [ "0" ],
  61588. "I1": [ 2788 ],
  61589. "I2": [ 1084 ],
  61590. "I3": [ 1052 ],
  61591. "O": [ 2787 ]
  61592. }
  61593. },
  61594. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_12": {
  61595. "hide_name": 0,
  61596. "type": "SB_LUT4",
  61597. "parameters": {
  61598. "LUT_INIT": "1100000011110011"
  61599. },
  61600. "attributes": {
  61601. "module_not_derived": "00000000000000000000000000000001",
  61602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61603. },
  61604. "port_directions": {
  61605. "I0": "input",
  61606. "I1": "input",
  61607. "I2": "input",
  61608. "I3": "input",
  61609. "O": "output"
  61610. },
  61611. "connections": {
  61612. "I0": [ "0" ],
  61613. "I1": [ 2768 ],
  61614. "I2": [ 1201 ],
  61615. "I3": [ 2789 ],
  61616. "O": [ 1081 ]
  61617. }
  61618. },
  61619. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_LUT4_O": {
  61620. "hide_name": 0,
  61621. "type": "SB_LUT4",
  61622. "parameters": {
  61623. "LUT_INIT": "0000111100110011"
  61624. },
  61625. "attributes": {
  61626. "module_not_derived": "00000000000000000000000000000001",
  61627. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61628. },
  61629. "port_directions": {
  61630. "I0": "input",
  61631. "I1": "input",
  61632. "I2": "input",
  61633. "I3": "input",
  61634. "O": "output"
  61635. },
  61636. "connections": {
  61637. "I0": [ "0" ],
  61638. "I1": [ 2790 ],
  61639. "I2": [ 1082 ],
  61640. "I3": [ 1052 ],
  61641. "O": [ 2789 ]
  61642. }
  61643. },
  61644. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_13": {
  61645. "hide_name": 0,
  61646. "type": "SB_LUT4",
  61647. "parameters": {
  61648. "LUT_INIT": "1100000011110011"
  61649. },
  61650. "attributes": {
  61651. "module_not_derived": "00000000000000000000000000000001",
  61652. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61653. },
  61654. "port_directions": {
  61655. "I0": "input",
  61656. "I1": "input",
  61657. "I2": "input",
  61658. "I3": "input",
  61659. "O": "output"
  61660. },
  61661. "connections": {
  61662. "I0": [ "0" ],
  61663. "I1": [ 2768 ],
  61664. "I2": [ 1199 ],
  61665. "I3": [ 2791 ],
  61666. "O": [ 1079 ]
  61667. }
  61668. },
  61669. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_LUT4_O": {
  61670. "hide_name": 0,
  61671. "type": "SB_LUT4",
  61672. "parameters": {
  61673. "LUT_INIT": "0000111100110011"
  61674. },
  61675. "attributes": {
  61676. "module_not_derived": "00000000000000000000000000000001",
  61677. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61678. },
  61679. "port_directions": {
  61680. "I0": "input",
  61681. "I1": "input",
  61682. "I2": "input",
  61683. "I3": "input",
  61684. "O": "output"
  61685. },
  61686. "connections": {
  61687. "I0": [ "0" ],
  61688. "I1": [ 2792 ],
  61689. "I2": [ 1080 ],
  61690. "I3": [ 1052 ],
  61691. "O": [ 2791 ]
  61692. }
  61693. },
  61694. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_14": {
  61695. "hide_name": 0,
  61696. "type": "SB_LUT4",
  61697. "parameters": {
  61698. "LUT_INIT": "1100000011110011"
  61699. },
  61700. "attributes": {
  61701. "module_not_derived": "00000000000000000000000000000001",
  61702. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61703. },
  61704. "port_directions": {
  61705. "I0": "input",
  61706. "I1": "input",
  61707. "I2": "input",
  61708. "I3": "input",
  61709. "O": "output"
  61710. },
  61711. "connections": {
  61712. "I0": [ "0" ],
  61713. "I1": [ 2768 ],
  61714. "I2": [ 1197 ],
  61715. "I3": [ 2793 ],
  61716. "O": [ 1077 ]
  61717. }
  61718. },
  61719. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_LUT4_O": {
  61720. "hide_name": 0,
  61721. "type": "SB_LUT4",
  61722. "parameters": {
  61723. "LUT_INIT": "0000111100110011"
  61724. },
  61725. "attributes": {
  61726. "module_not_derived": "00000000000000000000000000000001",
  61727. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61728. },
  61729. "port_directions": {
  61730. "I0": "input",
  61731. "I1": "input",
  61732. "I2": "input",
  61733. "I3": "input",
  61734. "O": "output"
  61735. },
  61736. "connections": {
  61737. "I0": [ "0" ],
  61738. "I1": [ 2794 ],
  61739. "I2": [ 1078 ],
  61740. "I3": [ 1052 ],
  61741. "O": [ 2793 ]
  61742. }
  61743. },
  61744. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_15": {
  61745. "hide_name": 0,
  61746. "type": "SB_LUT4",
  61747. "parameters": {
  61748. "LUT_INIT": "1100000011110011"
  61749. },
  61750. "attributes": {
  61751. "module_not_derived": "00000000000000000000000000000001",
  61752. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61753. },
  61754. "port_directions": {
  61755. "I0": "input",
  61756. "I1": "input",
  61757. "I2": "input",
  61758. "I3": "input",
  61759. "O": "output"
  61760. },
  61761. "connections": {
  61762. "I0": [ "0" ],
  61763. "I1": [ 2768 ],
  61764. "I2": [ 1195 ],
  61765. "I3": [ 2795 ],
  61766. "O": [ 1075 ]
  61767. }
  61768. },
  61769. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_15_I3_SB_LUT4_O": {
  61770. "hide_name": 0,
  61771. "type": "SB_LUT4",
  61772. "parameters": {
  61773. "LUT_INIT": "0000111100110011"
  61774. },
  61775. "attributes": {
  61776. "module_not_derived": "00000000000000000000000000000001",
  61777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61778. },
  61779. "port_directions": {
  61780. "I0": "input",
  61781. "I1": "input",
  61782. "I2": "input",
  61783. "I3": "input",
  61784. "O": "output"
  61785. },
  61786. "connections": {
  61787. "I0": [ "0" ],
  61788. "I1": [ 2796 ],
  61789. "I2": [ 1076 ],
  61790. "I3": [ 1052 ],
  61791. "O": [ 2795 ]
  61792. }
  61793. },
  61794. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_16": {
  61795. "hide_name": 0,
  61796. "type": "SB_LUT4",
  61797. "parameters": {
  61798. "LUT_INIT": "1100000011110011"
  61799. },
  61800. "attributes": {
  61801. "module_not_derived": "00000000000000000000000000000001",
  61802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61803. },
  61804. "port_directions": {
  61805. "I0": "input",
  61806. "I1": "input",
  61807. "I2": "input",
  61808. "I3": "input",
  61809. "O": "output"
  61810. },
  61811. "connections": {
  61812. "I0": [ "0" ],
  61813. "I1": [ 2768 ],
  61814. "I2": [ 1193 ],
  61815. "I3": [ 2797 ],
  61816. "O": [ 1073 ]
  61817. }
  61818. },
  61819. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_16_I3_SB_LUT4_O": {
  61820. "hide_name": 0,
  61821. "type": "SB_LUT4",
  61822. "parameters": {
  61823. "LUT_INIT": "0000111100110011"
  61824. },
  61825. "attributes": {
  61826. "module_not_derived": "00000000000000000000000000000001",
  61827. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61828. },
  61829. "port_directions": {
  61830. "I0": "input",
  61831. "I1": "input",
  61832. "I2": "input",
  61833. "I3": "input",
  61834. "O": "output"
  61835. },
  61836. "connections": {
  61837. "I0": [ "0" ],
  61838. "I1": [ 2798 ],
  61839. "I2": [ 1074 ],
  61840. "I3": [ 1052 ],
  61841. "O": [ 2797 ]
  61842. }
  61843. },
  61844. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_17": {
  61845. "hide_name": 0,
  61846. "type": "SB_LUT4",
  61847. "parameters": {
  61848. "LUT_INIT": "1100000011110011"
  61849. },
  61850. "attributes": {
  61851. "module_not_derived": "00000000000000000000000000000001",
  61852. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61853. },
  61854. "port_directions": {
  61855. "I0": "input",
  61856. "I1": "input",
  61857. "I2": "input",
  61858. "I3": "input",
  61859. "O": "output"
  61860. },
  61861. "connections": {
  61862. "I0": [ "0" ],
  61863. "I1": [ 2768 ],
  61864. "I2": [ 1191 ],
  61865. "I3": [ 2799 ],
  61866. "O": [ 1071 ]
  61867. }
  61868. },
  61869. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_17_I3_SB_LUT4_O": {
  61870. "hide_name": 0,
  61871. "type": "SB_LUT4",
  61872. "parameters": {
  61873. "LUT_INIT": "0000111100110011"
  61874. },
  61875. "attributes": {
  61876. "module_not_derived": "00000000000000000000000000000001",
  61877. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61878. },
  61879. "port_directions": {
  61880. "I0": "input",
  61881. "I1": "input",
  61882. "I2": "input",
  61883. "I3": "input",
  61884. "O": "output"
  61885. },
  61886. "connections": {
  61887. "I0": [ "0" ],
  61888. "I1": [ 2800 ],
  61889. "I2": [ 1072 ],
  61890. "I3": [ 1052 ],
  61891. "O": [ 2799 ]
  61892. }
  61893. },
  61894. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_18": {
  61895. "hide_name": 0,
  61896. "type": "SB_LUT4",
  61897. "parameters": {
  61898. "LUT_INIT": "1100000011110011"
  61899. },
  61900. "attributes": {
  61901. "module_not_derived": "00000000000000000000000000000001",
  61902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61903. },
  61904. "port_directions": {
  61905. "I0": "input",
  61906. "I1": "input",
  61907. "I2": "input",
  61908. "I3": "input",
  61909. "O": "output"
  61910. },
  61911. "connections": {
  61912. "I0": [ "0" ],
  61913. "I1": [ 2768 ],
  61914. "I2": [ 1189 ],
  61915. "I3": [ 2801 ],
  61916. "O": [ 1069 ]
  61917. }
  61918. },
  61919. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_18_I3_SB_LUT4_O": {
  61920. "hide_name": 0,
  61921. "type": "SB_LUT4",
  61922. "parameters": {
  61923. "LUT_INIT": "0000111100110011"
  61924. },
  61925. "attributes": {
  61926. "module_not_derived": "00000000000000000000000000000001",
  61927. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61928. },
  61929. "port_directions": {
  61930. "I0": "input",
  61931. "I1": "input",
  61932. "I2": "input",
  61933. "I3": "input",
  61934. "O": "output"
  61935. },
  61936. "connections": {
  61937. "I0": [ "0" ],
  61938. "I1": [ 2802 ],
  61939. "I2": [ 1070 ],
  61940. "I3": [ 1052 ],
  61941. "O": [ 2801 ]
  61942. }
  61943. },
  61944. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_19": {
  61945. "hide_name": 0,
  61946. "type": "SB_LUT4",
  61947. "parameters": {
  61948. "LUT_INIT": "1100000011110011"
  61949. },
  61950. "attributes": {
  61951. "module_not_derived": "00000000000000000000000000000001",
  61952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61953. },
  61954. "port_directions": {
  61955. "I0": "input",
  61956. "I1": "input",
  61957. "I2": "input",
  61958. "I3": "input",
  61959. "O": "output"
  61960. },
  61961. "connections": {
  61962. "I0": [ "0" ],
  61963. "I1": [ 2768 ],
  61964. "I2": [ 1187 ],
  61965. "I3": [ 2803 ],
  61966. "O": [ 1067 ]
  61967. }
  61968. },
  61969. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_19_I3_SB_LUT4_O": {
  61970. "hide_name": 0,
  61971. "type": "SB_LUT4",
  61972. "parameters": {
  61973. "LUT_INIT": "0000111100110011"
  61974. },
  61975. "attributes": {
  61976. "module_not_derived": "00000000000000000000000000000001",
  61977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  61978. },
  61979. "port_directions": {
  61980. "I0": "input",
  61981. "I1": "input",
  61982. "I2": "input",
  61983. "I3": "input",
  61984. "O": "output"
  61985. },
  61986. "connections": {
  61987. "I0": [ "0" ],
  61988. "I1": [ 2804 ],
  61989. "I2": [ 1068 ],
  61990. "I3": [ 1052 ],
  61991. "O": [ 2803 ]
  61992. }
  61993. },
  61994. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O": {
  61995. "hide_name": 0,
  61996. "type": "SB_LUT4",
  61997. "parameters": {
  61998. "LUT_INIT": "0000111100110011"
  61999. },
  62000. "attributes": {
  62001. "module_not_derived": "00000000000000000000000000000001",
  62002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62003. },
  62004. "port_directions": {
  62005. "I0": "input",
  62006. "I1": "input",
  62007. "I2": "input",
  62008. "I3": "input",
  62009. "O": "output"
  62010. },
  62011. "connections": {
  62012. "I0": [ "0" ],
  62013. "I1": [ 2805 ],
  62014. "I2": [ 1041 ],
  62015. "I3": [ 1052 ],
  62016. "O": [ 2784 ]
  62017. }
  62018. },
  62019. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_2": {
  62020. "hide_name": 0,
  62021. "type": "SB_LUT4",
  62022. "parameters": {
  62023. "LUT_INIT": "1100000011110011"
  62024. },
  62025. "attributes": {
  62026. "module_not_derived": "00000000000000000000000000000001",
  62027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62028. },
  62029. "port_directions": {
  62030. "I0": "input",
  62031. "I1": "input",
  62032. "I2": "input",
  62033. "I3": "input",
  62034. "O": "output"
  62035. },
  62036. "connections": {
  62037. "I0": [ "0" ],
  62038. "I1": [ 2768 ],
  62039. "I2": [ 1220 ],
  62040. "I3": [ 2806 ],
  62041. "O": [ 1103 ]
  62042. }
  62043. },
  62044. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_20": {
  62045. "hide_name": 0,
  62046. "type": "SB_LUT4",
  62047. "parameters": {
  62048. "LUT_INIT": "1100000011110011"
  62049. },
  62050. "attributes": {
  62051. "module_not_derived": "00000000000000000000000000000001",
  62052. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62053. },
  62054. "port_directions": {
  62055. "I0": "input",
  62056. "I1": "input",
  62057. "I2": "input",
  62058. "I3": "input",
  62059. "O": "output"
  62060. },
  62061. "connections": {
  62062. "I0": [ "0" ],
  62063. "I1": [ 2768 ],
  62064. "I2": [ 1237 ],
  62065. "I3": [ 2807 ],
  62066. "O": [ 1124 ]
  62067. }
  62068. },
  62069. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_20_I3_SB_LUT4_O": {
  62070. "hide_name": 0,
  62071. "type": "SB_LUT4",
  62072. "parameters": {
  62073. "LUT_INIT": "0000111100110011"
  62074. },
  62075. "attributes": {
  62076. "module_not_derived": "00000000000000000000000000000001",
  62077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62078. },
  62079. "port_directions": {
  62080. "I0": "input",
  62081. "I1": "input",
  62082. "I2": "input",
  62083. "I3": "input",
  62084. "O": "output"
  62085. },
  62086. "connections": {
  62087. "I0": [ "0" ],
  62088. "I1": [ 2808 ],
  62089. "I2": [ 1125 ],
  62090. "I3": [ 1052 ],
  62091. "O": [ 2807 ]
  62092. }
  62093. },
  62094. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_21": {
  62095. "hide_name": 0,
  62096. "type": "SB_LUT4",
  62097. "parameters": {
  62098. "LUT_INIT": "1100000011110011"
  62099. },
  62100. "attributes": {
  62101. "module_not_derived": "00000000000000000000000000000001",
  62102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62103. },
  62104. "port_directions": {
  62105. "I0": "input",
  62106. "I1": "input",
  62107. "I2": "input",
  62108. "I3": "input",
  62109. "O": "output"
  62110. },
  62111. "connections": {
  62112. "I0": [ "0" ],
  62113. "I1": [ 2768 ],
  62114. "I2": [ 1235 ],
  62115. "I3": [ 2809 ],
  62116. "O": [ 1122 ]
  62117. }
  62118. },
  62119. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_21_I3_SB_LUT4_O": {
  62120. "hide_name": 0,
  62121. "type": "SB_LUT4",
  62122. "parameters": {
  62123. "LUT_INIT": "0000111100110011"
  62124. },
  62125. "attributes": {
  62126. "module_not_derived": "00000000000000000000000000000001",
  62127. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62128. },
  62129. "port_directions": {
  62130. "I0": "input",
  62131. "I1": "input",
  62132. "I2": "input",
  62133. "I3": "input",
  62134. "O": "output"
  62135. },
  62136. "connections": {
  62137. "I0": [ "0" ],
  62138. "I1": [ 2810 ],
  62139. "I2": [ 1123 ],
  62140. "I3": [ 1052 ],
  62141. "O": [ 2809 ]
  62142. }
  62143. },
  62144. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_22": {
  62145. "hide_name": 0,
  62146. "type": "SB_LUT4",
  62147. "parameters": {
  62148. "LUT_INIT": "1100000011110011"
  62149. },
  62150. "attributes": {
  62151. "module_not_derived": "00000000000000000000000000000001",
  62152. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62153. },
  62154. "port_directions": {
  62155. "I0": "input",
  62156. "I1": "input",
  62157. "I2": "input",
  62158. "I3": "input",
  62159. "O": "output"
  62160. },
  62161. "connections": {
  62162. "I0": [ "0" ],
  62163. "I1": [ 2768 ],
  62164. "I2": [ 1233 ],
  62165. "I3": [ 2811 ],
  62166. "O": [ 1120 ]
  62167. }
  62168. },
  62169. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_22_I3_SB_LUT4_O": {
  62170. "hide_name": 0,
  62171. "type": "SB_LUT4",
  62172. "parameters": {
  62173. "LUT_INIT": "0000111100110011"
  62174. },
  62175. "attributes": {
  62176. "module_not_derived": "00000000000000000000000000000001",
  62177. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62178. },
  62179. "port_directions": {
  62180. "I0": "input",
  62181. "I1": "input",
  62182. "I2": "input",
  62183. "I3": "input",
  62184. "O": "output"
  62185. },
  62186. "connections": {
  62187. "I0": [ "0" ],
  62188. "I1": [ 2812 ],
  62189. "I2": [ 1121 ],
  62190. "I3": [ 1052 ],
  62191. "O": [ 2811 ]
  62192. }
  62193. },
  62194. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_23": {
  62195. "hide_name": 0,
  62196. "type": "SB_LUT4",
  62197. "parameters": {
  62198. "LUT_INIT": "1100000011110011"
  62199. },
  62200. "attributes": {
  62201. "module_not_derived": "00000000000000000000000000000001",
  62202. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62203. },
  62204. "port_directions": {
  62205. "I0": "input",
  62206. "I1": "input",
  62207. "I2": "input",
  62208. "I3": "input",
  62209. "O": "output"
  62210. },
  62211. "connections": {
  62212. "I0": [ "0" ],
  62213. "I1": [ 2768 ],
  62214. "I2": [ 1231 ],
  62215. "I3": [ 2813 ],
  62216. "O": [ 1118 ]
  62217. }
  62218. },
  62219. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_23_I3_SB_LUT4_O": {
  62220. "hide_name": 0,
  62221. "type": "SB_LUT4",
  62222. "parameters": {
  62223. "LUT_INIT": "0000111100110011"
  62224. },
  62225. "attributes": {
  62226. "module_not_derived": "00000000000000000000000000000001",
  62227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62228. },
  62229. "port_directions": {
  62230. "I0": "input",
  62231. "I1": "input",
  62232. "I2": "input",
  62233. "I3": "input",
  62234. "O": "output"
  62235. },
  62236. "connections": {
  62237. "I0": [ "0" ],
  62238. "I1": [ 2814 ],
  62239. "I2": [ 1119 ],
  62240. "I3": [ 1052 ],
  62241. "O": [ 2813 ]
  62242. }
  62243. },
  62244. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_24": {
  62245. "hide_name": 0,
  62246. "type": "SB_LUT4",
  62247. "parameters": {
  62248. "LUT_INIT": "1100000011110011"
  62249. },
  62250. "attributes": {
  62251. "module_not_derived": "00000000000000000000000000000001",
  62252. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62253. },
  62254. "port_directions": {
  62255. "I0": "input",
  62256. "I1": "input",
  62257. "I2": "input",
  62258. "I3": "input",
  62259. "O": "output"
  62260. },
  62261. "connections": {
  62262. "I0": [ "0" ],
  62263. "I1": [ 2768 ],
  62264. "I2": [ 1229 ],
  62265. "I3": [ 2815 ],
  62266. "O": [ 1116 ]
  62267. }
  62268. },
  62269. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_24_I3_SB_LUT4_O": {
  62270. "hide_name": 0,
  62271. "type": "SB_LUT4",
  62272. "parameters": {
  62273. "LUT_INIT": "0000111100110011"
  62274. },
  62275. "attributes": {
  62276. "module_not_derived": "00000000000000000000000000000001",
  62277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62278. },
  62279. "port_directions": {
  62280. "I0": "input",
  62281. "I1": "input",
  62282. "I2": "input",
  62283. "I3": "input",
  62284. "O": "output"
  62285. },
  62286. "connections": {
  62287. "I0": [ "0" ],
  62288. "I1": [ 2816 ],
  62289. "I2": [ 1117 ],
  62290. "I3": [ 1052 ],
  62291. "O": [ 2815 ]
  62292. }
  62293. },
  62294. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_25": {
  62295. "hide_name": 0,
  62296. "type": "SB_LUT4",
  62297. "parameters": {
  62298. "LUT_INIT": "1100000011110011"
  62299. },
  62300. "attributes": {
  62301. "module_not_derived": "00000000000000000000000000000001",
  62302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62303. },
  62304. "port_directions": {
  62305. "I0": "input",
  62306. "I1": "input",
  62307. "I2": "input",
  62308. "I3": "input",
  62309. "O": "output"
  62310. },
  62311. "connections": {
  62312. "I0": [ "0" ],
  62313. "I1": [ 2768 ],
  62314. "I2": [ 1227 ],
  62315. "I3": [ 2817 ],
  62316. "O": [ 1114 ]
  62317. }
  62318. },
  62319. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_25_I3_SB_LUT4_O": {
  62320. "hide_name": 0,
  62321. "type": "SB_LUT4",
  62322. "parameters": {
  62323. "LUT_INIT": "0000111100110011"
  62324. },
  62325. "attributes": {
  62326. "module_not_derived": "00000000000000000000000000000001",
  62327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62328. },
  62329. "port_directions": {
  62330. "I0": "input",
  62331. "I1": "input",
  62332. "I2": "input",
  62333. "I3": "input",
  62334. "O": "output"
  62335. },
  62336. "connections": {
  62337. "I0": [ "0" ],
  62338. "I1": [ 2818 ],
  62339. "I2": [ 1115 ],
  62340. "I3": [ 1052 ],
  62341. "O": [ 2817 ]
  62342. }
  62343. },
  62344. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_26": {
  62345. "hide_name": 0,
  62346. "type": "SB_LUT4",
  62347. "parameters": {
  62348. "LUT_INIT": "1100000011110011"
  62349. },
  62350. "attributes": {
  62351. "module_not_derived": "00000000000000000000000000000001",
  62352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62353. },
  62354. "port_directions": {
  62355. "I0": "input",
  62356. "I1": "input",
  62357. "I2": "input",
  62358. "I3": "input",
  62359. "O": "output"
  62360. },
  62361. "connections": {
  62362. "I0": [ "0" ],
  62363. "I1": [ 2768 ],
  62364. "I2": [ 1225 ],
  62365. "I3": [ 2819 ],
  62366. "O": [ 1108 ]
  62367. }
  62368. },
  62369. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_26_I3_SB_LUT4_O": {
  62370. "hide_name": 0,
  62371. "type": "SB_LUT4",
  62372. "parameters": {
  62373. "LUT_INIT": "0000111100110011"
  62374. },
  62375. "attributes": {
  62376. "module_not_derived": "00000000000000000000000000000001",
  62377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62378. },
  62379. "port_directions": {
  62380. "I0": "input",
  62381. "I1": "input",
  62382. "I2": "input",
  62383. "I3": "input",
  62384. "O": "output"
  62385. },
  62386. "connections": {
  62387. "I0": [ "0" ],
  62388. "I1": [ 2820 ],
  62389. "I2": [ 1109 ],
  62390. "I3": [ 1052 ],
  62391. "O": [ 2819 ]
  62392. }
  62393. },
  62394. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_27": {
  62395. "hide_name": 0,
  62396. "type": "SB_LUT4",
  62397. "parameters": {
  62398. "LUT_INIT": "1100000011110011"
  62399. },
  62400. "attributes": {
  62401. "module_not_derived": "00000000000000000000000000000001",
  62402. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62403. },
  62404. "port_directions": {
  62405. "I0": "input",
  62406. "I1": "input",
  62407. "I2": "input",
  62408. "I3": "input",
  62409. "O": "output"
  62410. },
  62411. "connections": {
  62412. "I0": [ "0" ],
  62413. "I1": [ 2768 ],
  62414. "I2": [ 1206 ],
  62415. "I3": [ 2821 ],
  62416. "O": [ 1087 ]
  62417. }
  62418. },
  62419. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_27_I3_SB_LUT4_O": {
  62420. "hide_name": 0,
  62421. "type": "SB_LUT4",
  62422. "parameters": {
  62423. "LUT_INIT": "0000111100110011"
  62424. },
  62425. "attributes": {
  62426. "module_not_derived": "00000000000000000000000000000001",
  62427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62428. },
  62429. "port_directions": {
  62430. "I0": "input",
  62431. "I1": "input",
  62432. "I2": "input",
  62433. "I3": "input",
  62434. "O": "output"
  62435. },
  62436. "connections": {
  62437. "I0": [ "0" ],
  62438. "I1": [ 2822 ],
  62439. "I2": [ 1088 ],
  62440. "I3": [ 1052 ],
  62441. "O": [ 2821 ]
  62442. }
  62443. },
  62444. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_28": {
  62445. "hide_name": 0,
  62446. "type": "SB_LUT4",
  62447. "parameters": {
  62448. "LUT_INIT": "1100000011110011"
  62449. },
  62450. "attributes": {
  62451. "module_not_derived": "00000000000000000000000000000001",
  62452. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62453. },
  62454. "port_directions": {
  62455. "I0": "input",
  62456. "I1": "input",
  62457. "I2": "input",
  62458. "I3": "input",
  62459. "O": "output"
  62460. },
  62461. "connections": {
  62462. "I0": [ "0" ],
  62463. "I1": [ 2768 ],
  62464. "I2": [ 1185 ],
  62465. "I3": [ 2823 ],
  62466. "O": [ 1065 ]
  62467. }
  62468. },
  62469. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_28_I3_SB_LUT4_O": {
  62470. "hide_name": 0,
  62471. "type": "SB_LUT4",
  62472. "parameters": {
  62473. "LUT_INIT": "0000111100110011"
  62474. },
  62475. "attributes": {
  62476. "module_not_derived": "00000000000000000000000000000001",
  62477. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62478. },
  62479. "port_directions": {
  62480. "I0": "input",
  62481. "I1": "input",
  62482. "I2": "input",
  62483. "I3": "input",
  62484. "O": "output"
  62485. },
  62486. "connections": {
  62487. "I0": [ "0" ],
  62488. "I1": [ 2824 ],
  62489. "I2": [ 1066 ],
  62490. "I3": [ 1052 ],
  62491. "O": [ 2823 ]
  62492. }
  62493. },
  62494. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_29": {
  62495. "hide_name": 0,
  62496. "type": "SB_LUT4",
  62497. "parameters": {
  62498. "LUT_INIT": "1100000011110011"
  62499. },
  62500. "attributes": {
  62501. "module_not_derived": "00000000000000000000000000000001",
  62502. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62503. },
  62504. "port_directions": {
  62505. "I0": "input",
  62506. "I1": "input",
  62507. "I2": "input",
  62508. "I3": "input",
  62509. "O": "output"
  62510. },
  62511. "connections": {
  62512. "I0": [ "0" ],
  62513. "I1": [ 2768 ],
  62514. "I2": [ 1059 ],
  62515. "I3": [ 2825 ],
  62516. "O": [ 1064 ]
  62517. }
  62518. },
  62519. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_29_I3_SB_LUT4_O": {
  62520. "hide_name": 0,
  62521. "type": "SB_LUT4",
  62522. "parameters": {
  62523. "LUT_INIT": "0000111100110011"
  62524. },
  62525. "attributes": {
  62526. "module_not_derived": "00000000000000000000000000000001",
  62527. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62528. },
  62529. "port_directions": {
  62530. "I0": "input",
  62531. "I1": "input",
  62532. "I2": "input",
  62533. "I3": "input",
  62534. "O": "output"
  62535. },
  62536. "connections": {
  62537. "I0": [ "0" ],
  62538. "I1": [ 2826 ],
  62539. "I2": [ 1062 ],
  62540. "I3": [ 1052 ],
  62541. "O": [ 2825 ]
  62542. }
  62543. },
  62544. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_2_I3_SB_LUT4_O": {
  62545. "hide_name": 0,
  62546. "type": "SB_LUT4",
  62547. "parameters": {
  62548. "LUT_INIT": "0000111100110011"
  62549. },
  62550. "attributes": {
  62551. "module_not_derived": "00000000000000000000000000000001",
  62552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62553. },
  62554. "port_directions": {
  62555. "I0": "input",
  62556. "I1": "input",
  62557. "I2": "input",
  62558. "I3": "input",
  62559. "O": "output"
  62560. },
  62561. "connections": {
  62562. "I0": [ "0" ],
  62563. "I1": [ 2827 ],
  62564. "I2": [ 1104 ],
  62565. "I3": [ 1052 ],
  62566. "O": [ 2806 ]
  62567. }
  62568. },
  62569. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_3": {
  62570. "hide_name": 0,
  62571. "type": "SB_LUT4",
  62572. "parameters": {
  62573. "LUT_INIT": "1100000011110011"
  62574. },
  62575. "attributes": {
  62576. "module_not_derived": "00000000000000000000000000000001",
  62577. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62578. },
  62579. "port_directions": {
  62580. "I0": "input",
  62581. "I1": "input",
  62582. "I2": "input",
  62583. "I3": "input",
  62584. "O": "output"
  62585. },
  62586. "connections": {
  62587. "I0": [ "0" ],
  62588. "I1": [ 2768 ],
  62589. "I2": [ 1218 ],
  62590. "I3": [ 2828 ],
  62591. "O": [ 1101 ]
  62592. }
  62593. },
  62594. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_3_I3_SB_LUT4_O": {
  62595. "hide_name": 0,
  62596. "type": "SB_LUT4",
  62597. "parameters": {
  62598. "LUT_INIT": "0000111100110011"
  62599. },
  62600. "attributes": {
  62601. "module_not_derived": "00000000000000000000000000000001",
  62602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62603. },
  62604. "port_directions": {
  62605. "I0": "input",
  62606. "I1": "input",
  62607. "I2": "input",
  62608. "I3": "input",
  62609. "O": "output"
  62610. },
  62611. "connections": {
  62612. "I0": [ "0" ],
  62613. "I1": [ 2829 ],
  62614. "I2": [ 1102 ],
  62615. "I3": [ 1052 ],
  62616. "O": [ 2828 ]
  62617. }
  62618. },
  62619. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_4": {
  62620. "hide_name": 0,
  62621. "type": "SB_LUT4",
  62622. "parameters": {
  62623. "LUT_INIT": "1100000011110011"
  62624. },
  62625. "attributes": {
  62626. "module_not_derived": "00000000000000000000000000000001",
  62627. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62628. },
  62629. "port_directions": {
  62630. "I0": "input",
  62631. "I1": "input",
  62632. "I2": "input",
  62633. "I3": "input",
  62634. "O": "output"
  62635. },
  62636. "connections": {
  62637. "I0": [ "0" ],
  62638. "I1": [ 2768 ],
  62639. "I2": [ 1216 ],
  62640. "I3": [ 2830 ],
  62641. "O": [ 1099 ]
  62642. }
  62643. },
  62644. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_4_I3_SB_LUT4_O": {
  62645. "hide_name": 0,
  62646. "type": "SB_LUT4",
  62647. "parameters": {
  62648. "LUT_INIT": "0000111100110011"
  62649. },
  62650. "attributes": {
  62651. "module_not_derived": "00000000000000000000000000000001",
  62652. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62653. },
  62654. "port_directions": {
  62655. "I0": "input",
  62656. "I1": "input",
  62657. "I2": "input",
  62658. "I3": "input",
  62659. "O": "output"
  62660. },
  62661. "connections": {
  62662. "I0": [ "0" ],
  62663. "I1": [ 2831 ],
  62664. "I2": [ 1100 ],
  62665. "I3": [ 1052 ],
  62666. "O": [ 2830 ]
  62667. }
  62668. },
  62669. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_5": {
  62670. "hide_name": 0,
  62671. "type": "SB_LUT4",
  62672. "parameters": {
  62673. "LUT_INIT": "1100000011110011"
  62674. },
  62675. "attributes": {
  62676. "module_not_derived": "00000000000000000000000000000001",
  62677. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62678. },
  62679. "port_directions": {
  62680. "I0": "input",
  62681. "I1": "input",
  62682. "I2": "input",
  62683. "I3": "input",
  62684. "O": "output"
  62685. },
  62686. "connections": {
  62687. "I0": [ "0" ],
  62688. "I1": [ 2768 ],
  62689. "I2": [ 1054 ],
  62690. "I3": [ 2832 ],
  62691. "O": [ 1097 ]
  62692. }
  62693. },
  62694. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_5_I3_SB_LUT4_O": {
  62695. "hide_name": 0,
  62696. "type": "SB_LUT4",
  62697. "parameters": {
  62698. "LUT_INIT": "0000111100110011"
  62699. },
  62700. "attributes": {
  62701. "module_not_derived": "00000000000000000000000000000001",
  62702. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62703. },
  62704. "port_directions": {
  62705. "I0": "input",
  62706. "I1": "input",
  62707. "I2": "input",
  62708. "I3": "input",
  62709. "O": "output"
  62710. },
  62711. "connections": {
  62712. "I0": [ "0" ],
  62713. "I1": [ 2833 ],
  62714. "I2": [ 1098 ],
  62715. "I3": [ 1052 ],
  62716. "O": [ 2832 ]
  62717. }
  62718. },
  62719. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_6": {
  62720. "hide_name": 0,
  62721. "type": "SB_LUT4",
  62722. "parameters": {
  62723. "LUT_INIT": "1100000011110011"
  62724. },
  62725. "attributes": {
  62726. "module_not_derived": "00000000000000000000000000000001",
  62727. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62728. },
  62729. "port_directions": {
  62730. "I0": "input",
  62731. "I1": "input",
  62732. "I2": "input",
  62733. "I3": "input",
  62734. "O": "output"
  62735. },
  62736. "connections": {
  62737. "I0": [ "0" ],
  62738. "I1": [ 2768 ],
  62739. "I2": [ 1213 ],
  62740. "I3": [ 2834 ],
  62741. "O": [ 1095 ]
  62742. }
  62743. },
  62744. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_7": {
  62745. "hide_name": 0,
  62746. "type": "SB_LUT4",
  62747. "parameters": {
  62748. "LUT_INIT": "1100000011110011"
  62749. },
  62750. "attributes": {
  62751. "module_not_derived": "00000000000000000000000000000001",
  62752. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62753. },
  62754. "port_directions": {
  62755. "I0": "input",
  62756. "I1": "input",
  62757. "I2": "input",
  62758. "I3": "input",
  62759. "O": "output"
  62760. },
  62761. "connections": {
  62762. "I0": [ "0" ],
  62763. "I1": [ 2768 ],
  62764. "I2": [ 1211 ],
  62765. "I3": [ 2835 ],
  62766. "O": [ 1093 ]
  62767. }
  62768. },
  62769. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_7_I3_SB_LUT4_O": {
  62770. "hide_name": 0,
  62771. "type": "SB_LUT4",
  62772. "parameters": {
  62773. "LUT_INIT": "0000111100110011"
  62774. },
  62775. "attributes": {
  62776. "module_not_derived": "00000000000000000000000000000001",
  62777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62778. },
  62779. "port_directions": {
  62780. "I0": "input",
  62781. "I1": "input",
  62782. "I2": "input",
  62783. "I3": "input",
  62784. "O": "output"
  62785. },
  62786. "connections": {
  62787. "I0": [ "0" ],
  62788. "I1": [ 2836 ],
  62789. "I2": [ 1094 ],
  62790. "I3": [ 1052 ],
  62791. "O": [ 2835 ]
  62792. }
  62793. },
  62794. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_8": {
  62795. "hide_name": 0,
  62796. "type": "SB_LUT4",
  62797. "parameters": {
  62798. "LUT_INIT": "1100000011110011"
  62799. },
  62800. "attributes": {
  62801. "module_not_derived": "00000000000000000000000000000001",
  62802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62803. },
  62804. "port_directions": {
  62805. "I0": "input",
  62806. "I1": "input",
  62807. "I2": "input",
  62808. "I3": "input",
  62809. "O": "output"
  62810. },
  62811. "connections": {
  62812. "I0": [ "0" ],
  62813. "I1": [ 2768 ],
  62814. "I2": [ 1209 ],
  62815. "I3": [ 2837 ],
  62816. "O": [ 1091 ]
  62817. }
  62818. },
  62819. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_8_I3_SB_LUT4_O": {
  62820. "hide_name": 0,
  62821. "type": "SB_LUT4",
  62822. "parameters": {
  62823. "LUT_INIT": "0000111100110011"
  62824. },
  62825. "attributes": {
  62826. "module_not_derived": "00000000000000000000000000000001",
  62827. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62828. },
  62829. "port_directions": {
  62830. "I0": "input",
  62831. "I1": "input",
  62832. "I2": "input",
  62833. "I3": "input",
  62834. "O": "output"
  62835. },
  62836. "connections": {
  62837. "I0": [ "0" ],
  62838. "I1": [ 2838 ],
  62839. "I2": [ 1092 ],
  62840. "I3": [ 1052 ],
  62841. "O": [ 2837 ]
  62842. }
  62843. },
  62844. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_9": {
  62845. "hide_name": 0,
  62846. "type": "SB_LUT4",
  62847. "parameters": {
  62848. "LUT_INIT": "1100000011110011"
  62849. },
  62850. "attributes": {
  62851. "module_not_derived": "00000000000000000000000000000001",
  62852. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62853. },
  62854. "port_directions": {
  62855. "I0": "input",
  62856. "I1": "input",
  62857. "I2": "input",
  62858. "I3": "input",
  62859. "O": "output"
  62860. },
  62861. "connections": {
  62862. "I0": [ "0" ],
  62863. "I1": [ 2768 ],
  62864. "I2": [ 1136 ],
  62865. "I3": [ 2839 ],
  62866. "O": [ 1089 ]
  62867. }
  62868. },
  62869. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_9_I3_SB_LUT4_O": {
  62870. "hide_name": 0,
  62871. "type": "SB_LUT4",
  62872. "parameters": {
  62873. "LUT_INIT": "0000111100110011"
  62874. },
  62875. "attributes": {
  62876. "module_not_derived": "00000000000000000000000000000001",
  62877. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62878. },
  62879. "port_directions": {
  62880. "I0": "input",
  62881. "I1": "input",
  62882. "I2": "input",
  62883. "I3": "input",
  62884. "O": "output"
  62885. },
  62886. "connections": {
  62887. "I0": [ "0" ],
  62888. "I1": [ 2840 ],
  62889. "I2": [ 1090 ],
  62890. "I3": [ 1052 ],
  62891. "O": [ 2839 ]
  62892. }
  62893. },
  62894. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  62895. "hide_name": 0,
  62896. "type": "SB_LUT4",
  62897. "parameters": {
  62898. "LUT_INIT": "0000111100110011"
  62899. },
  62900. "attributes": {
  62901. "module_not_derived": "00000000000000000000000000000001",
  62902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  62903. },
  62904. "port_directions": {
  62905. "I0": "input",
  62906. "I1": "input",
  62907. "I2": "input",
  62908. "I3": "input",
  62909. "O": "output"
  62910. },
  62911. "connections": {
  62912. "I0": [ "0" ],
  62913. "I1": [ 2841 ],
  62914. "I2": [ 1107 ],
  62915. "I3": [ 1052 ],
  62916. "O": [ 2783 ]
  62917. }
  62918. },
  62919. "cpu_I._zz_280__SB_LUT4_O": {
  62920. "hide_name": 0,
  62921. "type": "SB_LUT4",
  62922. "parameters": {
  62923. "LUT_INIT": "0111000001111010"
  62924. },
  62925. "attributes": {
  62926. "module_not_derived": "00000000000000000000000000000001",
  62927. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  62928. },
  62929. "port_directions": {
  62930. "I0": "input",
  62931. "I1": "input",
  62932. "I2": "input",
  62933. "I3": "input",
  62934. "O": "output"
  62935. },
  62936. "connections": {
  62937. "I0": [ 964 ],
  62938. "I1": [ 966 ],
  62939. "I2": [ 2467 ],
  62940. "I3": [ 2774 ],
  62941. "O": [ 2262 ]
  62942. }
  62943. },
  62944. "cpu_I._zz_280__SB_LUT4_O_I2_SB_LUT4_O": {
  62945. "hide_name": 0,
  62946. "type": "SB_LUT4",
  62947. "parameters": {
  62948. "LUT_INIT": "1000100000110000"
  62949. },
  62950. "attributes": {
  62951. "module_not_derived": "00000000000000000000000000000001",
  62952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  62953. },
  62954. "port_directions": {
  62955. "I0": "input",
  62956. "I1": "input",
  62957. "I2": "input",
  62958. "I3": "input",
  62959. "O": "output"
  62960. },
  62961. "connections": {
  62962. "I0": [ 960 ],
  62963. "I1": [ 2757 ],
  62964. "I2": [ 2842 ],
  62965. "I3": [ 2758 ],
  62966. "O": [ 2467 ]
  62967. }
  62968. },
  62969. "cpu_I._zz_280__SB_LUT4_O_I2_SB_LUT4_O_1": {
  62970. "hide_name": 0,
  62971. "type": "SB_LUT4",
  62972. "parameters": {
  62973. "LUT_INIT": "0000110000001010"
  62974. },
  62975. "attributes": {
  62976. "module_not_derived": "00000000000000000000000000000001",
  62977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  62978. },
  62979. "port_directions": {
  62980. "I0": "input",
  62981. "I1": "input",
  62982. "I2": "input",
  62983. "I3": "input",
  62984. "O": "output"
  62985. },
  62986. "connections": {
  62987. "I0": [ 2843 ],
  62988. "I1": [ 943 ],
  62989. "I2": [ 2757 ],
  62990. "I3": [ 2758 ],
  62991. "O": [ 1251 ]
  62992. }
  62993. },
  62994. "cpu_I._zz_281__SB_LUT4_O": {
  62995. "hide_name": 0,
  62996. "type": "SB_LUT4",
  62997. "parameters": {
  62998. "LUT_INIT": "0111000001111010"
  62999. },
  63000. "attributes": {
  63001. "module_not_derived": "00000000000000000000000000000001",
  63002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63003. },
  63004. "port_directions": {
  63005. "I0": "input",
  63006. "I1": "input",
  63007. "I2": "input",
  63008. "I3": "input",
  63009. "O": "output"
  63010. },
  63011. "connections": {
  63012. "I0": [ 964 ],
  63013. "I1": [ 966 ],
  63014. "I2": [ 2387 ],
  63015. "I3": [ 2844 ],
  63016. "O": [ 1054 ]
  63017. }
  63018. },
  63019. "cpu_I._zz_281__SB_LUT4_O_I2_SB_LUT4_O": {
  63020. "hide_name": 0,
  63021. "type": "SB_LUT4",
  63022. "parameters": {
  63023. "LUT_INIT": "0000110000001010"
  63024. },
  63025. "attributes": {
  63026. "module_not_derived": "00000000000000000000000000000001",
  63027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63028. },
  63029. "port_directions": {
  63030. "I0": "input",
  63031. "I1": "input",
  63032. "I2": "input",
  63033. "I3": "input",
  63034. "O": "output"
  63035. },
  63036. "connections": {
  63037. "I0": [ 2845 ],
  63038. "I1": [ 1002 ],
  63039. "I2": [ 2757 ],
  63040. "I3": [ 2758 ],
  63041. "O": [ 2386 ]
  63042. }
  63043. },
  63044. "cpu_I._zz_281__SB_LUT4_O_I2_SB_LUT4_O_1": {
  63045. "hide_name": 0,
  63046. "type": "SB_LUT4",
  63047. "parameters": {
  63048. "LUT_INIT": "1111000000000000"
  63049. },
  63050. "attributes": {
  63051. "module_not_derived": "00000000000000000000000000000001",
  63052. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  63053. },
  63054. "port_directions": {
  63055. "I0": "input",
  63056. "I1": "input",
  63057. "I2": "input",
  63058. "I3": "input",
  63059. "O": "output"
  63060. },
  63061. "connections": {
  63062. "I0": [ "0" ],
  63063. "I1": [ "0" ],
  63064. "I2": [ 2846 ],
  63065. "I3": [ 2847 ],
  63066. "O": [ 2387 ]
  63067. }
  63068. },
  63069. "cpu_I._zz_281__SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  63070. "hide_name": 0,
  63071. "type": "SB_LUT4",
  63072. "parameters": {
  63073. "LUT_INIT": "0000000000001111"
  63074. },
  63075. "attributes": {
  63076. "module_not_derived": "00000000000000000000000000000001",
  63077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  63078. },
  63079. "port_directions": {
  63080. "I0": "input",
  63081. "I1": "input",
  63082. "I2": "input",
  63083. "I3": "input",
  63084. "O": "output"
  63085. },
  63086. "connections": {
  63087. "I0": [ "0" ],
  63088. "I1": [ "0" ],
  63089. "I2": [ 2757 ],
  63090. "I3": [ 2758 ],
  63091. "O": [ 2847 ]
  63092. }
  63093. },
  63094. "cpu_I._zz_281__SB_LUT4_O_I3_SB_LUT4_O": {
  63095. "hide_name": 0,
  63096. "type": "SB_LUT4",
  63097. "parameters": {
  63098. "LUT_INIT": "0111000000000000"
  63099. },
  63100. "attributes": {
  63101. "module_not_derived": "00000000000000000000000000000001",
  63102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63103. },
  63104. "port_directions": {
  63105. "I0": "input",
  63106. "I1": "input",
  63107. "I2": "input",
  63108. "I3": "input",
  63109. "O": "output"
  63110. },
  63111. "connections": {
  63112. "I0": [ 1035 ],
  63113. "I1": [ 1133 ],
  63114. "I2": [ 1150 ],
  63115. "I3": [ 1152 ],
  63116. "O": [ 2844 ]
  63117. }
  63118. },
  63119. "cpu_I._zz_282__SB_LUT4_O": {
  63120. "hide_name": 0,
  63121. "type": "SB_LUT4",
  63122. "parameters": {
  63123. "LUT_INIT": "0111000001111010"
  63124. },
  63125. "attributes": {
  63126. "module_not_derived": "00000000000000000000000000000001",
  63127. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63128. },
  63129. "port_directions": {
  63130. "I0": "input",
  63131. "I1": "input",
  63132. "I2": "input",
  63133. "I3": "input",
  63134. "O": "output"
  63135. },
  63136. "connections": {
  63137. "I0": [ 964 ],
  63138. "I1": [ 966 ],
  63139. "I2": [ 2472 ],
  63140. "I3": [ 1129 ],
  63141. "O": [ 1039 ]
  63142. }
  63143. },
  63144. "cpu_I._zz_282__SB_LUT4_O_I2_SB_LUT4_O": {
  63145. "hide_name": 0,
  63146. "type": "SB_LUT4",
  63147. "parameters": {
  63148. "LUT_INIT": "1010000000001100"
  63149. },
  63150. "attributes": {
  63151. "module_not_derived": "00000000000000000000000000000001",
  63152. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63153. },
  63154. "port_directions": {
  63155. "I0": "input",
  63156. "I1": "input",
  63157. "I2": "input",
  63158. "I3": "input",
  63159. "O": "output"
  63160. },
  63161. "connections": {
  63162. "I0": [ 954 ],
  63163. "I1": [ 2848 ],
  63164. "I2": [ 2757 ],
  63165. "I3": [ 2758 ],
  63166. "O": [ 2472 ]
  63167. }
  63168. },
  63169. "cpu_I._zz_282__SB_LUT4_O_I2_SB_LUT4_O_1": {
  63170. "hide_name": 0,
  63171. "type": "SB_LUT4",
  63172. "parameters": {
  63173. "LUT_INIT": "0000101000001100"
  63174. },
  63175. "attributes": {
  63176. "module_not_derived": "00000000000000000000000000000001",
  63177. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63178. },
  63179. "port_directions": {
  63180. "I0": "input",
  63181. "I1": "input",
  63182. "I2": "input",
  63183. "I3": "input",
  63184. "O": "output"
  63185. },
  63186. "connections": {
  63187. "I0": [ 990 ],
  63188. "I1": [ 2849 ],
  63189. "I2": [ 2757 ],
  63190. "I3": [ 2758 ],
  63191. "O": [ 2471 ]
  63192. }
  63193. },
  63194. "cpu_I._zz_284__SB_LUT4_O": {
  63195. "hide_name": 0,
  63196. "type": "SB_LUT4",
  63197. "parameters": {
  63198. "LUT_INIT": "0111000001111010"
  63199. },
  63200. "attributes": {
  63201. "module_not_derived": "00000000000000000000000000000001",
  63202. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63203. },
  63204. "port_directions": {
  63205. "I0": "input",
  63206. "I1": "input",
  63207. "I2": "input",
  63208. "I3": "input",
  63209. "O": "output"
  63210. },
  63211. "connections": {
  63212. "I0": [ 964 ],
  63213. "I1": [ 966 ],
  63214. "I2": [ 2399 ],
  63215. "I3": [ 2850 ],
  63216. "O": [ 1136 ]
  63217. }
  63218. },
  63219. "cpu_I._zz_284__SB_LUT4_O_I2_SB_LUT4_O": {
  63220. "hide_name": 0,
  63221. "type": "SB_LUT4",
  63222. "parameters": {
  63223. "LUT_INIT": "0000101000001100"
  63224. },
  63225. "attributes": {
  63226. "module_not_derived": "00000000000000000000000000000001",
  63227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63228. },
  63229. "port_directions": {
  63230. "I0": "input",
  63231. "I1": "input",
  63232. "I2": "input",
  63233. "I3": "input",
  63234. "O": "output"
  63235. },
  63236. "connections": {
  63237. "I0": [ 950 ],
  63238. "I1": [ 2851 ],
  63239. "I2": [ 2757 ],
  63240. "I3": [ 2758 ],
  63241. "O": [ 2398 ]
  63242. }
  63243. },
  63244. "cpu_I._zz_284__SB_LUT4_O_I2_SB_LUT4_O_1": {
  63245. "hide_name": 0,
  63246. "type": "SB_LUT4",
  63247. "parameters": {
  63248. "LUT_INIT": "1111000000000000"
  63249. },
  63250. "attributes": {
  63251. "module_not_derived": "00000000000000000000000000000001",
  63252. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  63253. },
  63254. "port_directions": {
  63255. "I0": "input",
  63256. "I1": "input",
  63257. "I2": "input",
  63258. "I3": "input",
  63259. "O": "output"
  63260. },
  63261. "connections": {
  63262. "I0": [ "0" ],
  63263. "I1": [ "0" ],
  63264. "I2": [ 2852 ],
  63265. "I3": [ 2847 ],
  63266. "O": [ 2399 ]
  63267. }
  63268. },
  63269. "cpu_I._zz_284__SB_LUT4_O_I3_SB_LUT4_O": {
  63270. "hide_name": 0,
  63271. "type": "SB_LUT4",
  63272. "parameters": {
  63273. "LUT_INIT": "0111000000000000"
  63274. },
  63275. "attributes": {
  63276. "module_not_derived": "00000000000000000000000000000001",
  63277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63278. },
  63279. "port_directions": {
  63280. "I0": "input",
  63281. "I1": "input",
  63282. "I2": "input",
  63283. "I3": "input",
  63284. "O": "output"
  63285. },
  63286. "connections": {
  63287. "I0": [ 1037 ],
  63288. "I1": [ 1139 ],
  63289. "I2": [ 1138 ],
  63290. "I3": [ 1142 ],
  63291. "O": [ 2850 ]
  63292. }
  63293. },
  63294. "cpu_I._zz_291__SB_DFFE_Q": {
  63295. "hide_name": 0,
  63296. "type": "SB_DFFE",
  63297. "parameters": {
  63298. },
  63299. "attributes": {
  63300. "module_not_derived": "00000000000000000000000000000001",
  63301. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  63302. },
  63303. "port_directions": {
  63304. "C": "input",
  63305. "D": "input",
  63306. "E": "input",
  63307. "Q": "output"
  63308. },
  63309. "connections": {
  63310. "C": [ 42 ],
  63311. "D": [ 1298 ],
  63312. "E": [ 1472 ],
  63313. "Q": [ 1821 ]
  63314. }
  63315. },
  63316. "cpu_I._zz_293__SB_DFFE_Q": {
  63317. "hide_name": 0,
  63318. "type": "SB_DFFE",
  63319. "parameters": {
  63320. },
  63321. "attributes": {
  63322. "module_not_derived": "00000000000000000000000000000001",
  63323. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  63324. },
  63325. "port_directions": {
  63326. "C": "input",
  63327. "D": "input",
  63328. "E": "input",
  63329. "Q": "output"
  63330. },
  63331. "connections": {
  63332. "C": [ 42 ],
  63333. "D": [ 1343 ],
  63334. "E": [ 1472 ],
  63335. "Q": [ 2853 ]
  63336. }
  63337. },
  63338. "cpu_I._zz_293__SB_LUT4_I2": {
  63339. "hide_name": 0,
  63340. "type": "SB_LUT4",
  63341. "parameters": {
  63342. "LUT_INIT": "1100110011110000"
  63343. },
  63344. "attributes": {
  63345. "module_not_derived": "00000000000000000000000000000001",
  63346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63347. },
  63348. "port_directions": {
  63349. "I0": "input",
  63350. "I1": "input",
  63351. "I2": "input",
  63352. "I3": "input",
  63353. "O": "output"
  63354. },
  63355. "connections": {
  63356. "I0": [ "0" ],
  63357. "I1": [ 1530 ],
  63358. "I2": [ 2853 ],
  63359. "I3": [ 1994 ],
  63360. "O": [ 1988 ]
  63361. }
  63362. },
  63363. "cpu_I._zz_293__SB_LUT4_I2_1": {
  63364. "hide_name": 0,
  63365. "type": "SB_LUT4",
  63366. "parameters": {
  63367. "LUT_INIT": "0000001100000000"
  63368. },
  63369. "attributes": {
  63370. "module_not_derived": "00000000000000000000000000000001",
  63371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63372. },
  63373. "port_directions": {
  63374. "I0": "input",
  63375. "I1": "input",
  63376. "I2": "input",
  63377. "I3": "input",
  63378. "O": "output"
  63379. },
  63380. "connections": {
  63381. "I0": [ "0" ],
  63382. "I1": [ 1542 ],
  63383. "I2": [ 2853 ],
  63384. "I3": [ 2854 ],
  63385. "O": [ 2855 ]
  63386. }
  63387. },
  63388. "cpu_I._zz_293__SB_LUT4_I2_1_I3_SB_LUT4_O": {
  63389. "hide_name": 0,
  63390. "type": "SB_LUT4",
  63391. "parameters": {
  63392. "LUT_INIT": "0000000000000011"
  63393. },
  63394. "attributes": {
  63395. "module_not_derived": "00000000000000000000000000000001",
  63396. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63397. },
  63398. "port_directions": {
  63399. "I0": "input",
  63400. "I1": "input",
  63401. "I2": "input",
  63402. "I3": "input",
  63403. "O": "output"
  63404. },
  63405. "connections": {
  63406. "I0": [ "0" ],
  63407. "I1": [ 1538 ],
  63408. "I2": [ 1539 ],
  63409. "I3": [ 1541 ],
  63410. "O": [ 2854 ]
  63411. }
  63412. },
  63413. "cpu_I._zz_300__SB_LUT4_O": {
  63414. "hide_name": 0,
  63415. "type": "SB_LUT4",
  63416. "parameters": {
  63417. "LUT_INIT": "0000000000001100"
  63418. },
  63419. "attributes": {
  63420. "module_not_derived": "00000000000000000000000000000001",
  63421. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63422. },
  63423. "port_directions": {
  63424. "I0": "input",
  63425. "I1": "input",
  63426. "I2": "input",
  63427. "I3": "input",
  63428. "O": "output"
  63429. },
  63430. "connections": {
  63431. "I0": [ "0" ],
  63432. "I1": [ 1363 ],
  63433. "I2": [ 1543 ],
  63434. "I3": [ 1364 ],
  63435. "O": [ 1822 ]
  63436. }
  63437. },
  63438. "cpu_I._zz_302__SB_LUT4_O": {
  63439. "hide_name": 0,
  63440. "type": "SB_LUT4",
  63441. "parameters": {
  63442. "LUT_INIT": "1000111110000000"
  63443. },
  63444. "attributes": {
  63445. "module_not_derived": "00000000000000000000000000000001",
  63446. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63447. },
  63448. "port_directions": {
  63449. "I0": "input",
  63450. "I1": "input",
  63451. "I2": "input",
  63452. "I3": "input",
  63453. "O": "output"
  63454. },
  63455. "connections": {
  63456. "I0": [ 1536 ],
  63457. "I1": [ 1363 ],
  63458. "I2": [ 1543 ],
  63459. "I3": [ 2328 ],
  63460. "O": [ 2856 ]
  63461. }
  63462. },
  63463. "cpu_I._zz_313__SB_LUT4_O": {
  63464. "hide_name": 0,
  63465. "type": "SB_LUT4",
  63466. "parameters": {
  63467. "LUT_INIT": "1011001110000000"
  63468. },
  63469. "attributes": {
  63470. "module_not_derived": "00000000000000000000000000000001",
  63471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63472. },
  63473. "port_directions": {
  63474. "I0": "input",
  63475. "I1": "input",
  63476. "I2": "input",
  63477. "I3": "input",
  63478. "O": "output"
  63479. },
  63480. "connections": {
  63481. "I0": [ 1536 ],
  63482. "I1": [ 1363 ],
  63483. "I2": [ 1543 ],
  63484. "I3": [ 2328 ],
  63485. "O": [ 2857 ]
  63486. }
  63487. },
  63488. "cpu_I._zz_31__SB_LUT4_O": {
  63489. "hide_name": 0,
  63490. "type": "SB_LUT4",
  63491. "parameters": {
  63492. "LUT_INIT": "0000110000111111"
  63493. },
  63494. "attributes": {
  63495. "module_not_derived": "00000000000000000000000000000001",
  63496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63497. },
  63498. "port_directions": {
  63499. "I0": "input",
  63500. "I1": "input",
  63501. "I2": "input",
  63502. "I3": "input",
  63503. "O": "output"
  63504. },
  63505. "connections": {
  63506. "I0": [ "0" ],
  63507. "I1": [ 2858 ],
  63508. "I2": [ 2769 ],
  63509. "I3": [ 2859 ],
  63510. "O": [ 2860 ]
  63511. }
  63512. },
  63513. "cpu_I._zz_31__SB_LUT4_O_1": {
  63514. "hide_name": 0,
  63515. "type": "SB_LUT4",
  63516. "parameters": {
  63517. "LUT_INIT": "0000110000111111"
  63518. },
  63519. "attributes": {
  63520. "module_not_derived": "00000000000000000000000000000001",
  63521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63522. },
  63523. "port_directions": {
  63524. "I0": "input",
  63525. "I1": "input",
  63526. "I2": "input",
  63527. "I3": "input",
  63528. "O": "output"
  63529. },
  63530. "connections": {
  63531. "I0": [ "0" ],
  63532. "I1": [ 2858 ],
  63533. "I2": [ 2755 ],
  63534. "I3": [ 2762 ],
  63535. "O": [ 2861 ]
  63536. }
  63537. },
  63538. "cpu_I._zz_31__SB_LUT4_O_10": {
  63539. "hide_name": 0,
  63540. "type": "SB_LUT4",
  63541. "parameters": {
  63542. "LUT_INIT": "0000110000111111"
  63543. },
  63544. "attributes": {
  63545. "module_not_derived": "00000000000000000000000000000001",
  63546. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63547. },
  63548. "port_directions": {
  63549. "I0": "input",
  63550. "I1": "input",
  63551. "I2": "input",
  63552. "I3": "input",
  63553. "O": "output"
  63554. },
  63555. "connections": {
  63556. "I0": [ "0" ],
  63557. "I1": [ 2858 ],
  63558. "I2": [ 2850 ],
  63559. "I3": [ 2862 ],
  63560. "O": [ 2863 ]
  63561. }
  63562. },
  63563. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O": {
  63564. "hide_name": 0,
  63565. "type": "SB_LUT4",
  63566. "parameters": {
  63567. "LUT_INIT": "0110010011111101"
  63568. },
  63569. "attributes": {
  63570. "module_not_derived": "00000000000000000000000000000001",
  63571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63572. },
  63573. "port_directions": {
  63574. "I0": "input",
  63575. "I1": "input",
  63576. "I2": "input",
  63577. "I3": "input",
  63578. "O": "output"
  63579. },
  63580. "connections": {
  63581. "I0": [ 1246 ],
  63582. "I1": [ 1247 ],
  63583. "I2": [ 2864 ],
  63584. "I3": [ 2865 ],
  63585. "O": [ 2862 ]
  63586. }
  63587. },
  63588. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  63589. "hide_name": 0,
  63590. "type": "SB_LUT4",
  63591. "parameters": {
  63592. "LUT_INIT": "0010111110010010"
  63593. },
  63594. "attributes": {
  63595. "module_not_derived": "00000000000000000000000000000001",
  63596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63597. },
  63598. "port_directions": {
  63599. "I0": "input",
  63600. "I1": "input",
  63601. "I2": "input",
  63602. "I3": "input",
  63603. "O": "output"
  63604. },
  63605. "connections": {
  63606. "I0": [ 966 ],
  63607. "I1": [ 1250 ],
  63608. "I2": [ 2399 ],
  63609. "I3": [ 2866 ],
  63610. "O": [ 2864 ]
  63611. }
  63612. },
  63613. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  63614. "hide_name": 0,
  63615. "type": "SB_LUT4",
  63616. "parameters": {
  63617. "LUT_INIT": "0011111100000000"
  63618. },
  63619. "attributes": {
  63620. "module_not_derived": "00000000000000000000000000000001",
  63621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63622. },
  63623. "port_directions": {
  63624. "I0": "input",
  63625. "I1": "input",
  63626. "I2": "input",
  63627. "I3": "input",
  63628. "O": "output"
  63629. },
  63630. "connections": {
  63631. "I0": [ "0" ],
  63632. "I1": [ 2867 ],
  63633. "I2": [ 2868 ],
  63634. "I3": [ 2869 ],
  63635. "O": [ 2866 ]
  63636. }
  63637. },
  63638. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  63639. "hide_name": 0,
  63640. "type": "SB_LUT4",
  63641. "parameters": {
  63642. "LUT_INIT": "1111010101010011"
  63643. },
  63644. "attributes": {
  63645. "module_not_derived": "00000000000000000000000000000001",
  63646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63647. },
  63648. "port_directions": {
  63649. "I0": "input",
  63650. "I1": "input",
  63651. "I2": "input",
  63652. "I3": "input",
  63653. "O": "output"
  63654. },
  63655. "connections": {
  63656. "I0": [ 943 ],
  63657. "I1": [ 2870 ],
  63658. "I2": [ 2871 ],
  63659. "I3": [ 2872 ],
  63660. "O": [ 2869 ]
  63661. }
  63662. },
  63663. "cpu_I._zz_31__SB_LUT4_O_11": {
  63664. "hide_name": 0,
  63665. "type": "SB_LUT4",
  63666. "parameters": {
  63667. "LUT_INIT": "0000110000111111"
  63668. },
  63669. "attributes": {
  63670. "module_not_derived": "00000000000000000000000000000001",
  63671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63672. },
  63673. "port_directions": {
  63674. "I0": "input",
  63675. "I1": "input",
  63676. "I2": "input",
  63677. "I3": "input",
  63678. "O": "output"
  63679. },
  63680. "connections": {
  63681. "I0": [ "0" ],
  63682. "I1": [ 2858 ],
  63683. "I2": [ 2873 ],
  63684. "I3": [ 2874 ],
  63685. "O": [ 2875 ]
  63686. }
  63687. },
  63688. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O": {
  63689. "hide_name": 0,
  63690. "type": "SB_LUT4",
  63691. "parameters": {
  63692. "LUT_INIT": "0110010011111101"
  63693. },
  63694. "attributes": {
  63695. "module_not_derived": "00000000000000000000000000000001",
  63696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63697. },
  63698. "port_directions": {
  63699. "I0": "input",
  63700. "I1": "input",
  63701. "I2": "input",
  63702. "I3": "input",
  63703. "O": "output"
  63704. },
  63705. "connections": {
  63706. "I0": [ 1246 ],
  63707. "I1": [ 1247 ],
  63708. "I2": [ 2876 ],
  63709. "I3": [ 2877 ],
  63710. "O": [ 2874 ]
  63711. }
  63712. },
  63713. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  63714. "hide_name": 0,
  63715. "type": "SB_LUT4",
  63716. "parameters": {
  63717. "LUT_INIT": "0010111110010010"
  63718. },
  63719. "attributes": {
  63720. "module_not_derived": "00000000000000000000000000000001",
  63721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63722. },
  63723. "port_directions": {
  63724. "I0": "input",
  63725. "I1": "input",
  63726. "I2": "input",
  63727. "I3": "input",
  63728. "O": "output"
  63729. },
  63730. "connections": {
  63731. "I0": [ 966 ],
  63732. "I1": [ 1250 ],
  63733. "I2": [ 2522 ],
  63734. "I3": [ 2878 ],
  63735. "O": [ 2876 ]
  63736. }
  63737. },
  63738. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  63739. "hide_name": 0,
  63740. "type": "SB_LUT4",
  63741. "parameters": {
  63742. "LUT_INIT": "1111000000001111"
  63743. },
  63744. "attributes": {
  63745. "module_not_derived": "00000000000000000000000000000001",
  63746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  63747. },
  63748. "port_directions": {
  63749. "I0": "input",
  63750. "I1": "input",
  63751. "I2": "input",
  63752. "I3": "input",
  63753. "O": "output"
  63754. },
  63755. "connections": {
  63756. "I0": [ "0" ],
  63757. "I1": [ "0" ],
  63758. "I2": [ 2522 ],
  63759. "I3": [ 2878 ],
  63760. "O": [ 2879 ]
  63761. }
  63762. },
  63763. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  63764. "hide_name": 0,
  63765. "type": "SB_LUT4",
  63766. "parameters": {
  63767. "LUT_INIT": "0011111100000000"
  63768. },
  63769. "attributes": {
  63770. "module_not_derived": "00000000000000000000000000000001",
  63771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63772. },
  63773. "port_directions": {
  63774. "I0": "input",
  63775. "I1": "input",
  63776. "I2": "input",
  63777. "I3": "input",
  63778. "O": "output"
  63779. },
  63780. "connections": {
  63781. "I0": [ "0" ],
  63782. "I1": [ 2880 ],
  63783. "I2": [ 2868 ],
  63784. "I3": [ 2881 ],
  63785. "O": [ 2878 ]
  63786. }
  63787. },
  63788. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  63789. "hide_name": 0,
  63790. "type": "SB_LUT4",
  63791. "parameters": {
  63792. "LUT_INIT": "1111010101010011"
  63793. },
  63794. "attributes": {
  63795. "module_not_derived": "00000000000000000000000000000001",
  63796. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63797. },
  63798. "port_directions": {
  63799. "I0": "input",
  63800. "I1": "input",
  63801. "I2": "input",
  63802. "I3": "input",
  63803. "O": "output"
  63804. },
  63805. "connections": {
  63806. "I0": [ 943 ],
  63807. "I1": [ 2882 ],
  63808. "I2": [ 2871 ],
  63809. "I3": [ 2872 ],
  63810. "O": [ 2881 ]
  63811. }
  63812. },
  63813. "cpu_I._zz_31__SB_LUT4_O_12": {
  63814. "hide_name": 0,
  63815. "type": "SB_LUT4",
  63816. "parameters": {
  63817. "LUT_INIT": "0000110000111111"
  63818. },
  63819. "attributes": {
  63820. "module_not_derived": "00000000000000000000000000000001",
  63821. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63822. },
  63823. "port_directions": {
  63824. "I0": "input",
  63825. "I1": "input",
  63826. "I2": "input",
  63827. "I3": "input",
  63828. "O": "output"
  63829. },
  63830. "connections": {
  63831. "I0": [ "0" ],
  63832. "I1": [ 2858 ],
  63833. "I2": [ 2883 ],
  63834. "I3": [ 2884 ],
  63835. "O": [ 2885 ]
  63836. }
  63837. },
  63838. "cpu_I._zz_31__SB_LUT4_O_13": {
  63839. "hide_name": 0,
  63840. "type": "SB_LUT4",
  63841. "parameters": {
  63842. "LUT_INIT": "0000110000111111"
  63843. },
  63844. "attributes": {
  63845. "module_not_derived": "00000000000000000000000000000001",
  63846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63847. },
  63848. "port_directions": {
  63849. "I0": "input",
  63850. "I1": "input",
  63851. "I2": "input",
  63852. "I3": "input",
  63853. "O": "output"
  63854. },
  63855. "connections": {
  63856. "I0": [ "0" ],
  63857. "I1": [ 2858 ],
  63858. "I2": [ 2886 ],
  63859. "I3": [ 2887 ],
  63860. "O": [ 2888 ]
  63861. }
  63862. },
  63863. "cpu_I._zz_31__SB_LUT4_O_13_I2_SB_LUT4_O": {
  63864. "hide_name": 0,
  63865. "type": "SB_LUT4",
  63866. "parameters": {
  63867. "LUT_INIT": "0011111100000000"
  63868. },
  63869. "attributes": {
  63870. "module_not_derived": "00000000000000000000000000000001",
  63871. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  63872. },
  63873. "port_directions": {
  63874. "I0": "input",
  63875. "I1": "input",
  63876. "I2": "input",
  63877. "I3": "input",
  63878. "O": "output"
  63879. },
  63880. "connections": {
  63881. "I0": [ "0" ],
  63882. "I1": [ 1163 ],
  63883. "I2": [ 1034 ],
  63884. "I3": [ 2889 ],
  63885. "O": [ 2886 ]
  63886. }
  63887. },
  63888. "cpu_I._zz_31__SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  63889. "hide_name": 0,
  63890. "type": "SB_LUT4",
  63891. "parameters": {
  63892. "LUT_INIT": "0001001101011111"
  63893. },
  63894. "attributes": {
  63895. "module_not_derived": "00000000000000000000000000000001",
  63896. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63897. },
  63898. "port_directions": {
  63899. "I0": "input",
  63900. "I1": "input",
  63901. "I2": "input",
  63902. "I3": "input",
  63903. "O": "output"
  63904. },
  63905. "connections": {
  63906. "I0": [ 1082 ],
  63907. "I1": [ 1037 ],
  63908. "I2": [ 1043 ],
  63909. "I3": [ 2890 ],
  63910. "O": [ 2889 ]
  63911. }
  63912. },
  63913. "cpu_I._zz_31__SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  63914. "hide_name": 0,
  63915. "type": "SB_DFFER",
  63916. "parameters": {
  63917. },
  63918. "attributes": {
  63919. "module_not_derived": "00000000000000000000000000000001",
  63920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  63921. },
  63922. "port_directions": {
  63923. "C": "input",
  63924. "D": "input",
  63925. "E": "input",
  63926. "Q": "output",
  63927. "R": "input"
  63928. },
  63929. "connections": {
  63930. "C": [ 42 ],
  63931. "D": [ 1201 ],
  63932. "E": [ 1040 ],
  63933. "Q": [ 2890 ],
  63934. "R": [ 127 ]
  63935. }
  63936. },
  63937. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O": {
  63938. "hide_name": 0,
  63939. "type": "SB_LUT4",
  63940. "parameters": {
  63941. "LUT_INIT": "0110010011111101"
  63942. },
  63943. "attributes": {
  63944. "module_not_derived": "00000000000000000000000000000001",
  63945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63946. },
  63947. "port_directions": {
  63948. "I0": "input",
  63949. "I1": "input",
  63950. "I2": "input",
  63951. "I3": "input",
  63952. "O": "output"
  63953. },
  63954. "connections": {
  63955. "I0": [ 1246 ],
  63956. "I1": [ 1247 ],
  63957. "I2": [ 2891 ],
  63958. "I3": [ 2892 ],
  63959. "O": [ 2887 ]
  63960. }
  63961. },
  63962. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  63963. "hide_name": 0,
  63964. "type": "SB_LUT4",
  63965. "parameters": {
  63966. "LUT_INIT": "0010111110010010"
  63967. },
  63968. "attributes": {
  63969. "module_not_derived": "00000000000000000000000000000001",
  63970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63971. },
  63972. "port_directions": {
  63973. "I0": "input",
  63974. "I1": "input",
  63975. "I2": "input",
  63976. "I3": "input",
  63977. "O": "output"
  63978. },
  63979. "connections": {
  63980. "I0": [ 966 ],
  63981. "I1": [ 1250 ],
  63982. "I2": [ 2526 ],
  63983. "I3": [ 2893 ],
  63984. "O": [ 2891 ]
  63985. }
  63986. },
  63987. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  63988. "hide_name": 0,
  63989. "type": "SB_LUT4",
  63990. "parameters": {
  63991. "LUT_INIT": "0001001001001000"
  63992. },
  63993. "attributes": {
  63994. "module_not_derived": "00000000000000000000000000000001",
  63995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  63996. },
  63997. "port_directions": {
  63998. "I0": "input",
  63999. "I1": "input",
  64000. "I2": "input",
  64001. "I3": "input",
  64002. "O": "output"
  64003. },
  64004. "connections": {
  64005. "I0": [ 2523 ],
  64006. "I1": [ 2526 ],
  64007. "I2": [ 2894 ],
  64008. "I3": [ 2893 ],
  64009. "O": [ 2895 ]
  64010. }
  64011. },
  64012. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64013. "hide_name": 0,
  64014. "type": "SB_LUT4",
  64015. "parameters": {
  64016. "LUT_INIT": "0011111100000000"
  64017. },
  64018. "attributes": {
  64019. "module_not_derived": "00000000000000000000000000000001",
  64020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64021. },
  64022. "port_directions": {
  64023. "I0": "input",
  64024. "I1": "input",
  64025. "I2": "input",
  64026. "I3": "input",
  64027. "O": "output"
  64028. },
  64029. "connections": {
  64030. "I0": [ "0" ],
  64031. "I1": [ 2896 ],
  64032. "I2": [ 2868 ],
  64033. "I3": [ 2897 ],
  64034. "O": [ 2893 ]
  64035. }
  64036. },
  64037. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  64038. "hide_name": 0,
  64039. "type": "SB_LUT4",
  64040. "parameters": {
  64041. "LUT_INIT": "1111010101010011"
  64042. },
  64043. "attributes": {
  64044. "module_not_derived": "00000000000000000000000000000001",
  64045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64046. },
  64047. "port_directions": {
  64048. "I0": "input",
  64049. "I1": "input",
  64050. "I2": "input",
  64051. "I3": "input",
  64052. "O": "output"
  64053. },
  64054. "connections": {
  64055. "I0": [ 943 ],
  64056. "I1": [ 2898 ],
  64057. "I2": [ 2871 ],
  64058. "I3": [ 2872 ],
  64059. "O": [ 2897 ]
  64060. }
  64061. },
  64062. "cpu_I._zz_31__SB_LUT4_O_14": {
  64063. "hide_name": 0,
  64064. "type": "SB_LUT4",
  64065. "parameters": {
  64066. "LUT_INIT": "0000110000111111"
  64067. },
  64068. "attributes": {
  64069. "module_not_derived": "00000000000000000000000000000001",
  64070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64071. },
  64072. "port_directions": {
  64073. "I0": "input",
  64074. "I1": "input",
  64075. "I2": "input",
  64076. "I3": "input",
  64077. "O": "output"
  64078. },
  64079. "connections": {
  64080. "I0": [ "0" ],
  64081. "I1": [ 2858 ],
  64082. "I2": [ 2899 ],
  64083. "I3": [ 2900 ],
  64084. "O": [ 2901 ]
  64085. }
  64086. },
  64087. "cpu_I._zz_31__SB_LUT4_O_15": {
  64088. "hide_name": 0,
  64089. "type": "SB_LUT4",
  64090. "parameters": {
  64091. "LUT_INIT": "0000110000111111"
  64092. },
  64093. "attributes": {
  64094. "module_not_derived": "00000000000000000000000000000001",
  64095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64096. },
  64097. "port_directions": {
  64098. "I0": "input",
  64099. "I1": "input",
  64100. "I2": "input",
  64101. "I3": "input",
  64102. "O": "output"
  64103. },
  64104. "connections": {
  64105. "I0": [ "0" ],
  64106. "I1": [ 2858 ],
  64107. "I2": [ 2902 ],
  64108. "I3": [ 2903 ],
  64109. "O": [ 2904 ]
  64110. }
  64111. },
  64112. "cpu_I._zz_31__SB_LUT4_O_15_I2_SB_LUT4_O": {
  64113. "hide_name": 0,
  64114. "type": "SB_LUT4",
  64115. "parameters": {
  64116. "LUT_INIT": "0011111100000000"
  64117. },
  64118. "attributes": {
  64119. "module_not_derived": "00000000000000000000000000000001",
  64120. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64121. },
  64122. "port_directions": {
  64123. "I0": "input",
  64124. "I1": "input",
  64125. "I2": "input",
  64126. "I3": "input",
  64127. "O": "output"
  64128. },
  64129. "connections": {
  64130. "I0": [ "0" ],
  64131. "I1": [ 1161 ],
  64132. "I2": [ 1034 ],
  64133. "I3": [ 2905 ],
  64134. "O": [ 2902 ]
  64135. }
  64136. },
  64137. "cpu_I._zz_31__SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64138. "hide_name": 0,
  64139. "type": "SB_LUT4",
  64140. "parameters": {
  64141. "LUT_INIT": "0001001101011111"
  64142. },
  64143. "attributes": {
  64144. "module_not_derived": "00000000000000000000000000000001",
  64145. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64146. },
  64147. "port_directions": {
  64148. "I0": "input",
  64149. "I1": "input",
  64150. "I2": "input",
  64151. "I3": "input",
  64152. "O": "output"
  64153. },
  64154. "connections": {
  64155. "I0": [ 1078 ],
  64156. "I1": [ 1037 ],
  64157. "I2": [ 1043 ],
  64158. "I3": [ 2906 ],
  64159. "O": [ 2905 ]
  64160. }
  64161. },
  64162. "cpu_I._zz_31__SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  64163. "hide_name": 0,
  64164. "type": "SB_DFFER",
  64165. "parameters": {
  64166. },
  64167. "attributes": {
  64168. "module_not_derived": "00000000000000000000000000000001",
  64169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  64170. },
  64171. "port_directions": {
  64172. "C": "input",
  64173. "D": "input",
  64174. "E": "input",
  64175. "Q": "output",
  64176. "R": "input"
  64177. },
  64178. "connections": {
  64179. "C": [ 42 ],
  64180. "D": [ 1197 ],
  64181. "E": [ 1040 ],
  64182. "Q": [ 2906 ],
  64183. "R": [ 127 ]
  64184. }
  64185. },
  64186. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O": {
  64187. "hide_name": 0,
  64188. "type": "SB_LUT4",
  64189. "parameters": {
  64190. "LUT_INIT": "0110010011111101"
  64191. },
  64192. "attributes": {
  64193. "module_not_derived": "00000000000000000000000000000001",
  64194. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64195. },
  64196. "port_directions": {
  64197. "I0": "input",
  64198. "I1": "input",
  64199. "I2": "input",
  64200. "I3": "input",
  64201. "O": "output"
  64202. },
  64203. "connections": {
  64204. "I0": [ 1246 ],
  64205. "I1": [ 1247 ],
  64206. "I2": [ 2907 ],
  64207. "I3": [ 2908 ],
  64208. "O": [ 2903 ]
  64209. }
  64210. },
  64211. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  64212. "hide_name": 0,
  64213. "type": "SB_LUT4",
  64214. "parameters": {
  64215. "LUT_INIT": "0010111110010010"
  64216. },
  64217. "attributes": {
  64218. "module_not_derived": "00000000000000000000000000000001",
  64219. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64220. },
  64221. "port_directions": {
  64222. "I0": "input",
  64223. "I1": "input",
  64224. "I2": "input",
  64225. "I3": "input",
  64226. "O": "output"
  64227. },
  64228. "connections": {
  64229. "I0": [ 966 ],
  64230. "I1": [ 1250 ],
  64231. "I2": [ 2527 ],
  64232. "I3": [ 2909 ],
  64233. "O": [ 2907 ]
  64234. }
  64235. },
  64236. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  64237. "hide_name": 0,
  64238. "type": "SB_LUT4",
  64239. "parameters": {
  64240. "LUT_INIT": "1111000000001111"
  64241. },
  64242. "attributes": {
  64243. "module_not_derived": "00000000000000000000000000000001",
  64244. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  64245. },
  64246. "port_directions": {
  64247. "I0": "input",
  64248. "I1": "input",
  64249. "I2": "input",
  64250. "I3": "input",
  64251. "O": "output"
  64252. },
  64253. "connections": {
  64254. "I0": [ "0" ],
  64255. "I1": [ "0" ],
  64256. "I2": [ 2527 ],
  64257. "I3": [ 2909 ],
  64258. "O": [ 2910 ]
  64259. }
  64260. },
  64261. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64262. "hide_name": 0,
  64263. "type": "SB_LUT4",
  64264. "parameters": {
  64265. "LUT_INIT": "0011111100000000"
  64266. },
  64267. "attributes": {
  64268. "module_not_derived": "00000000000000000000000000000001",
  64269. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64270. },
  64271. "port_directions": {
  64272. "I0": "input",
  64273. "I1": "input",
  64274. "I2": "input",
  64275. "I3": "input",
  64276. "O": "output"
  64277. },
  64278. "connections": {
  64279. "I0": [ "0" ],
  64280. "I1": [ 2911 ],
  64281. "I2": [ 2868 ],
  64282. "I3": [ 2912 ],
  64283. "O": [ 2909 ]
  64284. }
  64285. },
  64286. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  64287. "hide_name": 0,
  64288. "type": "SB_LUT4",
  64289. "parameters": {
  64290. "LUT_INIT": "1111010101010011"
  64291. },
  64292. "attributes": {
  64293. "module_not_derived": "00000000000000000000000000000001",
  64294. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64295. },
  64296. "port_directions": {
  64297. "I0": "input",
  64298. "I1": "input",
  64299. "I2": "input",
  64300. "I3": "input",
  64301. "O": "output"
  64302. },
  64303. "connections": {
  64304. "I0": [ 943 ],
  64305. "I1": [ 2913 ],
  64306. "I2": [ 2871 ],
  64307. "I3": [ 2872 ],
  64308. "O": [ 2912 ]
  64309. }
  64310. },
  64311. "cpu_I._zz_31__SB_LUT4_O_16": {
  64312. "hide_name": 0,
  64313. "type": "SB_LUT4",
  64314. "parameters": {
  64315. "LUT_INIT": "0000110000111111"
  64316. },
  64317. "attributes": {
  64318. "module_not_derived": "00000000000000000000000000000001",
  64319. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64320. },
  64321. "port_directions": {
  64322. "I0": "input",
  64323. "I1": "input",
  64324. "I2": "input",
  64325. "I3": "input",
  64326. "O": "output"
  64327. },
  64328. "connections": {
  64329. "I0": [ "0" ],
  64330. "I1": [ 2858 ],
  64331. "I2": [ 2914 ],
  64332. "I3": [ 2915 ],
  64333. "O": [ 2916 ]
  64334. }
  64335. },
  64336. "cpu_I._zz_31__SB_LUT4_O_17": {
  64337. "hide_name": 0,
  64338. "type": "SB_LUT4",
  64339. "parameters": {
  64340. "LUT_INIT": "0000110000111111"
  64341. },
  64342. "attributes": {
  64343. "module_not_derived": "00000000000000000000000000000001",
  64344. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64345. },
  64346. "port_directions": {
  64347. "I0": "input",
  64348. "I1": "input",
  64349. "I2": "input",
  64350. "I3": "input",
  64351. "O": "output"
  64352. },
  64353. "connections": {
  64354. "I0": [ "0" ],
  64355. "I1": [ 2858 ],
  64356. "I2": [ 2917 ],
  64357. "I3": [ 2918 ],
  64358. "O": [ 2919 ]
  64359. }
  64360. },
  64361. "cpu_I._zz_31__SB_LUT4_O_18": {
  64362. "hide_name": 0,
  64363. "type": "SB_LUT4",
  64364. "parameters": {
  64365. "LUT_INIT": "0000110000111111"
  64366. },
  64367. "attributes": {
  64368. "module_not_derived": "00000000000000000000000000000001",
  64369. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64370. },
  64371. "port_directions": {
  64372. "I0": "input",
  64373. "I1": "input",
  64374. "I2": "input",
  64375. "I3": "input",
  64376. "O": "output"
  64377. },
  64378. "connections": {
  64379. "I0": [ "0" ],
  64380. "I1": [ 2858 ],
  64381. "I2": [ 2920 ],
  64382. "I3": [ 2921 ],
  64383. "O": [ 2922 ]
  64384. }
  64385. },
  64386. "cpu_I._zz_31__SB_LUT4_O_19": {
  64387. "hide_name": 0,
  64388. "type": "SB_LUT4",
  64389. "parameters": {
  64390. "LUT_INIT": "0000110000111111"
  64391. },
  64392. "attributes": {
  64393. "module_not_derived": "00000000000000000000000000000001",
  64394. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64395. },
  64396. "port_directions": {
  64397. "I0": "input",
  64398. "I1": "input",
  64399. "I2": "input",
  64400. "I3": "input",
  64401. "O": "output"
  64402. },
  64403. "connections": {
  64404. "I0": [ "0" ],
  64405. "I1": [ 2858 ],
  64406. "I2": [ 2923 ],
  64407. "I3": [ 2924 ],
  64408. "O": [ 2925 ]
  64409. }
  64410. },
  64411. "cpu_I._zz_31__SB_LUT4_O_19_I2_SB_LUT4_O": {
  64412. "hide_name": 0,
  64413. "type": "SB_LUT4",
  64414. "parameters": {
  64415. "LUT_INIT": "0011111100000000"
  64416. },
  64417. "attributes": {
  64418. "module_not_derived": "00000000000000000000000000000001",
  64419. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64420. },
  64421. "port_directions": {
  64422. "I0": "input",
  64423. "I1": "input",
  64424. "I2": "input",
  64425. "I3": "input",
  64426. "O": "output"
  64427. },
  64428. "connections": {
  64429. "I0": [ "0" ],
  64430. "I1": [ 1157 ],
  64431. "I2": [ 1034 ],
  64432. "I3": [ 2926 ],
  64433. "O": [ 2923 ]
  64434. }
  64435. },
  64436. "cpu_I._zz_31__SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64437. "hide_name": 0,
  64438. "type": "SB_LUT4",
  64439. "parameters": {
  64440. "LUT_INIT": "0001001101011111"
  64441. },
  64442. "attributes": {
  64443. "module_not_derived": "00000000000000000000000000000001",
  64444. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64445. },
  64446. "port_directions": {
  64447. "I0": "input",
  64448. "I1": "input",
  64449. "I2": "input",
  64450. "I3": "input",
  64451. "O": "output"
  64452. },
  64453. "connections": {
  64454. "I0": [ 1070 ],
  64455. "I1": [ 1037 ],
  64456. "I2": [ 1043 ],
  64457. "I3": [ 2927 ],
  64458. "O": [ 2926 ]
  64459. }
  64460. },
  64461. "cpu_I._zz_31__SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  64462. "hide_name": 0,
  64463. "type": "SB_DFFER",
  64464. "parameters": {
  64465. },
  64466. "attributes": {
  64467. "module_not_derived": "00000000000000000000000000000001",
  64468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  64469. },
  64470. "port_directions": {
  64471. "C": "input",
  64472. "D": "input",
  64473. "E": "input",
  64474. "Q": "output",
  64475. "R": "input"
  64476. },
  64477. "connections": {
  64478. "C": [ 42 ],
  64479. "D": [ 1189 ],
  64480. "E": [ 1040 ],
  64481. "Q": [ 2927 ],
  64482. "R": [ 127 ]
  64483. }
  64484. },
  64485. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O": {
  64486. "hide_name": 0,
  64487. "type": "SB_LUT4",
  64488. "parameters": {
  64489. "LUT_INIT": "0110010011111101"
  64490. },
  64491. "attributes": {
  64492. "module_not_derived": "00000000000000000000000000000001",
  64493. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64494. },
  64495. "port_directions": {
  64496. "I0": "input",
  64497. "I1": "input",
  64498. "I2": "input",
  64499. "I3": "input",
  64500. "O": "output"
  64501. },
  64502. "connections": {
  64503. "I0": [ 1246 ],
  64504. "I1": [ 1247 ],
  64505. "I2": [ 2928 ],
  64506. "I3": [ 2929 ],
  64507. "O": [ 2924 ]
  64508. }
  64509. },
  64510. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  64511. "hide_name": 0,
  64512. "type": "SB_LUT4",
  64513. "parameters": {
  64514. "LUT_INIT": "0010111110010010"
  64515. },
  64516. "attributes": {
  64517. "module_not_derived": "00000000000000000000000000000001",
  64518. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64519. },
  64520. "port_directions": {
  64521. "I0": "input",
  64522. "I1": "input",
  64523. "I2": "input",
  64524. "I3": "input",
  64525. "O": "output"
  64526. },
  64527. "connections": {
  64528. "I0": [ 966 ],
  64529. "I1": [ 1250 ],
  64530. "I2": [ 2398 ],
  64531. "I3": [ 2930 ],
  64532. "O": [ 2928 ]
  64533. }
  64534. },
  64535. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  64536. "hide_name": 0,
  64537. "type": "SB_LUT4",
  64538. "parameters": {
  64539. "LUT_INIT": "1111000000001111"
  64540. },
  64541. "attributes": {
  64542. "module_not_derived": "00000000000000000000000000000001",
  64543. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  64544. },
  64545. "port_directions": {
  64546. "I0": "input",
  64547. "I1": "input",
  64548. "I2": "input",
  64549. "I3": "input",
  64550. "O": "output"
  64551. },
  64552. "connections": {
  64553. "I0": [ "0" ],
  64554. "I1": [ "0" ],
  64555. "I2": [ 2398 ],
  64556. "I3": [ 2930 ],
  64557. "O": [ 2931 ]
  64558. }
  64559. },
  64560. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64561. "hide_name": 0,
  64562. "type": "SB_LUT4",
  64563. "parameters": {
  64564. "LUT_INIT": "0011111100000000"
  64565. },
  64566. "attributes": {
  64567. "module_not_derived": "00000000000000000000000000000001",
  64568. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64569. },
  64570. "port_directions": {
  64571. "I0": "input",
  64572. "I1": "input",
  64573. "I2": "input",
  64574. "I3": "input",
  64575. "O": "output"
  64576. },
  64577. "connections": {
  64578. "I0": [ "0" ],
  64579. "I1": [ 2932 ],
  64580. "I2": [ 2868 ],
  64581. "I3": [ 2933 ],
  64582. "O": [ 2930 ]
  64583. }
  64584. },
  64585. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  64586. "hide_name": 0,
  64587. "type": "SB_LUT4",
  64588. "parameters": {
  64589. "LUT_INIT": "1111010101010011"
  64590. },
  64591. "attributes": {
  64592. "module_not_derived": "00000000000000000000000000000001",
  64593. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64594. },
  64595. "port_directions": {
  64596. "I0": "input",
  64597. "I1": "input",
  64598. "I2": "input",
  64599. "I3": "input",
  64600. "O": "output"
  64601. },
  64602. "connections": {
  64603. "I0": [ 943 ],
  64604. "I1": [ 2934 ],
  64605. "I2": [ 2871 ],
  64606. "I3": [ 2872 ],
  64607. "O": [ 2933 ]
  64608. }
  64609. },
  64610. "cpu_I._zz_31__SB_LUT4_O_2": {
  64611. "hide_name": 0,
  64612. "type": "SB_LUT4",
  64613. "parameters": {
  64614. "LUT_INIT": "0000110000111111"
  64615. },
  64616. "attributes": {
  64617. "module_not_derived": "00000000000000000000000000000001",
  64618. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64619. },
  64620. "port_directions": {
  64621. "I0": "input",
  64622. "I1": "input",
  64623. "I2": "input",
  64624. "I3": "input",
  64625. "O": "output"
  64626. },
  64627. "connections": {
  64628. "I0": [ "0" ],
  64629. "I1": [ 2858 ],
  64630. "I2": [ 1129 ],
  64631. "I3": [ 2935 ],
  64632. "O": [ 2936 ]
  64633. }
  64634. },
  64635. "cpu_I._zz_31__SB_LUT4_O_20": {
  64636. "hide_name": 0,
  64637. "type": "SB_LUT4",
  64638. "parameters": {
  64639. "LUT_INIT": "0000110000111111"
  64640. },
  64641. "attributes": {
  64642. "module_not_derived": "00000000000000000000000000000001",
  64643. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64644. },
  64645. "port_directions": {
  64646. "I0": "input",
  64647. "I1": "input",
  64648. "I2": "input",
  64649. "I3": "input",
  64650. "O": "output"
  64651. },
  64652. "connections": {
  64653. "I0": [ "0" ],
  64654. "I1": [ 2858 ],
  64655. "I2": [ 2937 ],
  64656. "I3": [ 2938 ],
  64657. "O": [ 2939 ]
  64658. }
  64659. },
  64660. "cpu_I._zz_31__SB_LUT4_O_21": {
  64661. "hide_name": 0,
  64662. "type": "SB_LUT4",
  64663. "parameters": {
  64664. "LUT_INIT": "0000110000111111"
  64665. },
  64666. "attributes": {
  64667. "module_not_derived": "00000000000000000000000000000001",
  64668. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64669. },
  64670. "port_directions": {
  64671. "I0": "input",
  64672. "I1": "input",
  64673. "I2": "input",
  64674. "I3": "input",
  64675. "O": "output"
  64676. },
  64677. "connections": {
  64678. "I0": [ "0" ],
  64679. "I1": [ 2858 ],
  64680. "I2": [ 2940 ],
  64681. "I3": [ 2941 ],
  64682. "O": [ 2942 ]
  64683. }
  64684. },
  64685. "cpu_I._zz_31__SB_LUT4_O_22": {
  64686. "hide_name": 0,
  64687. "type": "SB_LUT4",
  64688. "parameters": {
  64689. "LUT_INIT": "0000110000111111"
  64690. },
  64691. "attributes": {
  64692. "module_not_derived": "00000000000000000000000000000001",
  64693. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64694. },
  64695. "port_directions": {
  64696. "I0": "input",
  64697. "I1": "input",
  64698. "I2": "input",
  64699. "I3": "input",
  64700. "O": "output"
  64701. },
  64702. "connections": {
  64703. "I0": [ "0" ],
  64704. "I1": [ 2858 ],
  64705. "I2": [ 2943 ],
  64706. "I3": [ 2944 ],
  64707. "O": [ 2945 ]
  64708. }
  64709. },
  64710. "cpu_I._zz_31__SB_LUT4_O_22_I2_SB_LUT4_O": {
  64711. "hide_name": 0,
  64712. "type": "SB_LUT4",
  64713. "parameters": {
  64714. "LUT_INIT": "0011111100000000"
  64715. },
  64716. "attributes": {
  64717. "module_not_derived": "00000000000000000000000000000001",
  64718. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64719. },
  64720. "port_directions": {
  64721. "I0": "input",
  64722. "I1": "input",
  64723. "I2": "input",
  64724. "I3": "input",
  64725. "O": "output"
  64726. },
  64727. "connections": {
  64728. "I0": [ "0" ],
  64729. "I1": [ 1181 ],
  64730. "I2": [ 1034 ],
  64731. "I3": [ 2946 ],
  64732. "O": [ 2943 ]
  64733. }
  64734. },
  64735. "cpu_I._zz_31__SB_LUT4_O_22_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64736. "hide_name": 0,
  64737. "type": "SB_LUT4",
  64738. "parameters": {
  64739. "LUT_INIT": "0001001101011111"
  64740. },
  64741. "attributes": {
  64742. "module_not_derived": "00000000000000000000000000000001",
  64743. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64744. },
  64745. "port_directions": {
  64746. "I0": "input",
  64747. "I1": "input",
  64748. "I2": "input",
  64749. "I3": "input",
  64750. "O": "output"
  64751. },
  64752. "connections": {
  64753. "I0": [ 1123 ],
  64754. "I1": [ 1037 ],
  64755. "I2": [ 1043 ],
  64756. "I3": [ 2947 ],
  64757. "O": [ 2946 ]
  64758. }
  64759. },
  64760. "cpu_I._zz_31__SB_LUT4_O_22_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  64761. "hide_name": 0,
  64762. "type": "SB_DFFER",
  64763. "parameters": {
  64764. },
  64765. "attributes": {
  64766. "module_not_derived": "00000000000000000000000000000001",
  64767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  64768. },
  64769. "port_directions": {
  64770. "C": "input",
  64771. "D": "input",
  64772. "E": "input",
  64773. "Q": "output",
  64774. "R": "input"
  64775. },
  64776. "connections": {
  64777. "C": [ 42 ],
  64778. "D": [ 1235 ],
  64779. "E": [ 1040 ],
  64780. "Q": [ 2947 ],
  64781. "R": [ 127 ]
  64782. }
  64783. },
  64784. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O": {
  64785. "hide_name": 0,
  64786. "type": "SB_LUT4",
  64787. "parameters": {
  64788. "LUT_INIT": "0110010011111101"
  64789. },
  64790. "attributes": {
  64791. "module_not_derived": "00000000000000000000000000000001",
  64792. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64793. },
  64794. "port_directions": {
  64795. "I0": "input",
  64796. "I1": "input",
  64797. "I2": "input",
  64798. "I3": "input",
  64799. "O": "output"
  64800. },
  64801. "connections": {
  64802. "I0": [ 1246 ],
  64803. "I1": [ 1247 ],
  64804. "I2": [ 2948 ],
  64805. "I3": [ 2949 ],
  64806. "O": [ 2944 ]
  64807. }
  64808. },
  64809. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  64810. "hide_name": 0,
  64811. "type": "SB_LUT4",
  64812. "parameters": {
  64813. "LUT_INIT": "0010111110010010"
  64814. },
  64815. "attributes": {
  64816. "module_not_derived": "00000000000000000000000000000001",
  64817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64818. },
  64819. "port_directions": {
  64820. "I0": "input",
  64821. "I1": "input",
  64822. "I2": "input",
  64823. "I3": "input",
  64824. "O": "output"
  64825. },
  64826. "connections": {
  64827. "I0": [ 966 ],
  64828. "I1": [ 1250 ],
  64829. "I2": [ 2392 ],
  64830. "I3": [ 2950 ],
  64831. "O": [ 2948 ]
  64832. }
  64833. },
  64834. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  64835. "hide_name": 0,
  64836. "type": "SB_LUT4",
  64837. "parameters": {
  64838. "LUT_INIT": "1111000000001111"
  64839. },
  64840. "attributes": {
  64841. "module_not_derived": "00000000000000000000000000000001",
  64842. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  64843. },
  64844. "port_directions": {
  64845. "I0": "input",
  64846. "I1": "input",
  64847. "I2": "input",
  64848. "I3": "input",
  64849. "O": "output"
  64850. },
  64851. "connections": {
  64852. "I0": [ "0" ],
  64853. "I1": [ "0" ],
  64854. "I2": [ 2392 ],
  64855. "I3": [ 2950 ],
  64856. "O": [ 2951 ]
  64857. }
  64858. },
  64859. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  64860. "hide_name": 0,
  64861. "type": "SB_LUT4",
  64862. "parameters": {
  64863. "LUT_INIT": "0011111100000000"
  64864. },
  64865. "attributes": {
  64866. "module_not_derived": "00000000000000000000000000000001",
  64867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64868. },
  64869. "port_directions": {
  64870. "I0": "input",
  64871. "I1": "input",
  64872. "I2": "input",
  64873. "I3": "input",
  64874. "O": "output"
  64875. },
  64876. "connections": {
  64877. "I0": [ "0" ],
  64878. "I1": [ 2952 ],
  64879. "I2": [ 2868 ],
  64880. "I3": [ 2953 ],
  64881. "O": [ 2950 ]
  64882. }
  64883. },
  64884. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  64885. "hide_name": 0,
  64886. "type": "SB_LUT4",
  64887. "parameters": {
  64888. "LUT_INIT": "1111010101010011"
  64889. },
  64890. "attributes": {
  64891. "module_not_derived": "00000000000000000000000000000001",
  64892. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  64893. },
  64894. "port_directions": {
  64895. "I0": "input",
  64896. "I1": "input",
  64897. "I2": "input",
  64898. "I3": "input",
  64899. "O": "output"
  64900. },
  64901. "connections": {
  64902. "I0": [ 943 ],
  64903. "I1": [ 2954 ],
  64904. "I2": [ 2871 ],
  64905. "I3": [ 2872 ],
  64906. "O": [ 2953 ]
  64907. }
  64908. },
  64909. "cpu_I._zz_31__SB_LUT4_O_23": {
  64910. "hide_name": 0,
  64911. "type": "SB_LUT4",
  64912. "parameters": {
  64913. "LUT_INIT": "0000110000111111"
  64914. },
  64915. "attributes": {
  64916. "module_not_derived": "00000000000000000000000000000001",
  64917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64918. },
  64919. "port_directions": {
  64920. "I0": "input",
  64921. "I1": "input",
  64922. "I2": "input",
  64923. "I3": "input",
  64924. "O": "output"
  64925. },
  64926. "connections": {
  64927. "I0": [ "0" ],
  64928. "I1": [ 2858 ],
  64929. "I2": [ 2955 ],
  64930. "I3": [ 2956 ],
  64931. "O": [ 2957 ]
  64932. }
  64933. },
  64934. "cpu_I._zz_31__SB_LUT4_O_24": {
  64935. "hide_name": 0,
  64936. "type": "SB_LUT4",
  64937. "parameters": {
  64938. "LUT_INIT": "0000110000111111"
  64939. },
  64940. "attributes": {
  64941. "module_not_derived": "00000000000000000000000000000001",
  64942. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64943. },
  64944. "port_directions": {
  64945. "I0": "input",
  64946. "I1": "input",
  64947. "I2": "input",
  64948. "I3": "input",
  64949. "O": "output"
  64950. },
  64951. "connections": {
  64952. "I0": [ "0" ],
  64953. "I1": [ 2858 ],
  64954. "I2": [ 2958 ],
  64955. "I3": [ 2959 ],
  64956. "O": [ 2960 ]
  64957. }
  64958. },
  64959. "cpu_I._zz_31__SB_LUT4_O_25": {
  64960. "hide_name": 0,
  64961. "type": "SB_LUT4",
  64962. "parameters": {
  64963. "LUT_INIT": "0000110000111111"
  64964. },
  64965. "attributes": {
  64966. "module_not_derived": "00000000000000000000000000000001",
  64967. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64968. },
  64969. "port_directions": {
  64970. "I0": "input",
  64971. "I1": "input",
  64972. "I2": "input",
  64973. "I3": "input",
  64974. "O": "output"
  64975. },
  64976. "connections": {
  64977. "I0": [ "0" ],
  64978. "I1": [ 2858 ],
  64979. "I2": [ 2961 ],
  64980. "I3": [ 2962 ],
  64981. "O": [ 2963 ]
  64982. }
  64983. },
  64984. "cpu_I._zz_31__SB_LUT4_O_26": {
  64985. "hide_name": 0,
  64986. "type": "SB_LUT4",
  64987. "parameters": {
  64988. "LUT_INIT": "0000110000111111"
  64989. },
  64990. "attributes": {
  64991. "module_not_derived": "00000000000000000000000000000001",
  64992. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  64993. },
  64994. "port_directions": {
  64995. "I0": "input",
  64996. "I1": "input",
  64997. "I2": "input",
  64998. "I3": "input",
  64999. "O": "output"
  65000. },
  65001. "connections": {
  65002. "I0": [ "0" ],
  65003. "I1": [ 2858 ],
  65004. "I2": [ 2964 ],
  65005. "I3": [ 2965 ],
  65006. "O": [ 2966 ]
  65007. }
  65008. },
  65009. "cpu_I._zz_31__SB_LUT4_O_27": {
  65010. "hide_name": 0,
  65011. "type": "SB_LUT4",
  65012. "parameters": {
  65013. "LUT_INIT": "0000110000111111"
  65014. },
  65015. "attributes": {
  65016. "module_not_derived": "00000000000000000000000000000001",
  65017. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65018. },
  65019. "port_directions": {
  65020. "I0": "input",
  65021. "I1": "input",
  65022. "I2": "input",
  65023. "I3": "input",
  65024. "O": "output"
  65025. },
  65026. "connections": {
  65027. "I0": [ "0" ],
  65028. "I1": [ 2858 ],
  65029. "I2": [ 2967 ],
  65030. "I3": [ 2968 ],
  65031. "O": [ 2969 ]
  65032. }
  65033. },
  65034. "cpu_I._zz_31__SB_LUT4_O_28": {
  65035. "hide_name": 0,
  65036. "type": "SB_LUT4",
  65037. "parameters": {
  65038. "LUT_INIT": "0111011100100111"
  65039. },
  65040. "attributes": {
  65041. "module_not_derived": "00000000000000000000000000000001",
  65042. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65043. },
  65044. "port_directions": {
  65045. "I0": "input",
  65046. "I1": "input",
  65047. "I2": "input",
  65048. "I3": "input",
  65049. "O": "output"
  65050. },
  65051. "connections": {
  65052. "I0": [ 2858 ],
  65053. "I1": [ 2774 ],
  65054. "I2": [ 2777 ],
  65055. "I3": [ 2780 ],
  65056. "O": [ 2970 ]
  65057. }
  65058. },
  65059. "cpu_I._zz_31__SB_LUT4_O_29": {
  65060. "hide_name": 0,
  65061. "type": "SB_LUT4",
  65062. "parameters": {
  65063. "LUT_INIT": "0000110000111111"
  65064. },
  65065. "attributes": {
  65066. "module_not_derived": "00000000000000000000000000000001",
  65067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65068. },
  65069. "port_directions": {
  65070. "I0": "input",
  65071. "I1": "input",
  65072. "I2": "input",
  65073. "I3": "input",
  65074. "O": "output"
  65075. },
  65076. "connections": {
  65077. "I0": [ "0" ],
  65078. "I1": [ 2858 ],
  65079. "I2": [ 1253 ],
  65080. "I3": [ 1245 ],
  65081. "O": [ 2971 ]
  65082. }
  65083. },
  65084. "cpu_I._zz_31__SB_LUT4_O_2_I3_SB_LUT4_O": {
  65085. "hide_name": 0,
  65086. "type": "SB_LUT4",
  65087. "parameters": {
  65088. "LUT_INIT": "0110010011111101"
  65089. },
  65090. "attributes": {
  65091. "module_not_derived": "00000000000000000000000000000001",
  65092. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65093. },
  65094. "port_directions": {
  65095. "I0": "input",
  65096. "I1": "input",
  65097. "I2": "input",
  65098. "I3": "input",
  65099. "O": "output"
  65100. },
  65101. "connections": {
  65102. "I0": [ 1246 ],
  65103. "I1": [ 1247 ],
  65104. "I2": [ 2972 ],
  65105. "I3": [ 2973 ],
  65106. "O": [ 2935 ]
  65107. }
  65108. },
  65109. "cpu_I._zz_31__SB_LUT4_O_2_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  65110. "hide_name": 0,
  65111. "type": "SB_LUT4",
  65112. "parameters": {
  65113. "LUT_INIT": "0010111110010010"
  65114. },
  65115. "attributes": {
  65116. "module_not_derived": "00000000000000000000000000000001",
  65117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65118. },
  65119. "port_directions": {
  65120. "I0": "input",
  65121. "I1": "input",
  65122. "I2": "input",
  65123. "I3": "input",
  65124. "O": "output"
  65125. },
  65126. "connections": {
  65127. "I0": [ 966 ],
  65128. "I1": [ 1250 ],
  65129. "I2": [ 2472 ],
  65130. "I3": [ 2359 ],
  65131. "O": [ 2972 ]
  65132. }
  65133. },
  65134. "cpu_I._zz_31__SB_LUT4_O_3": {
  65135. "hide_name": 0,
  65136. "type": "SB_LUT4",
  65137. "parameters": {
  65138. "LUT_INIT": "0000110000111111"
  65139. },
  65140. "attributes": {
  65141. "module_not_derived": "00000000000000000000000000000001",
  65142. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65143. },
  65144. "port_directions": {
  65145. "I0": "input",
  65146. "I1": "input",
  65147. "I2": "input",
  65148. "I3": "input",
  65149. "O": "output"
  65150. },
  65151. "connections": {
  65152. "I0": [ "0" ],
  65153. "I1": [ 2858 ],
  65154. "I2": [ 2974 ],
  65155. "I3": [ 2975 ],
  65156. "O": [ 2976 ]
  65157. }
  65158. },
  65159. "cpu_I._zz_31__SB_LUT4_O_30": {
  65160. "hide_name": 0,
  65161. "type": "SB_LUT4",
  65162. "parameters": {
  65163. "LUT_INIT": "0111011101110010"
  65164. },
  65165. "attributes": {
  65166. "module_not_derived": "00000000000000000000000000000001",
  65167. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65168. },
  65169. "port_directions": {
  65170. "I0": "input",
  65171. "I1": "input",
  65172. "I2": "input",
  65173. "I3": "input",
  65174. "O": "output"
  65175. },
  65176. "connections": {
  65177. "I0": [ 2858 ],
  65178. "I1": [ 2977 ],
  65179. "I2": [ 2978 ],
  65180. "I3": [ 2979 ],
  65181. "O": [ 2980 ]
  65182. }
  65183. },
  65184. "cpu_I._zz_31__SB_LUT4_O_31": {
  65185. "hide_name": 0,
  65186. "type": "SB_LUT4",
  65187. "parameters": {
  65188. "LUT_INIT": "0111011101110010"
  65189. },
  65190. "attributes": {
  65191. "module_not_derived": "00000000000000000000000000000001",
  65192. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65193. },
  65194. "port_directions": {
  65195. "I0": "input",
  65196. "I1": "input",
  65197. "I2": "input",
  65198. "I3": "input",
  65199. "O": "output"
  65200. },
  65201. "connections": {
  65202. "I0": [ 2858 ],
  65203. "I1": [ 2981 ],
  65204. "I2": [ 2982 ],
  65205. "I3": [ 2983 ],
  65206. "O": [ 2984 ]
  65207. }
  65208. },
  65209. "cpu_I._zz_31__SB_LUT4_O_31_I1_SB_LUT4_O": {
  65210. "hide_name": 0,
  65211. "type": "SB_LUT4",
  65212. "parameters": {
  65213. "LUT_INIT": "0011111100000000"
  65214. },
  65215. "attributes": {
  65216. "module_not_derived": "00000000000000000000000000000001",
  65217. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65218. },
  65219. "port_directions": {
  65220. "I0": "input",
  65221. "I1": "input",
  65222. "I2": "input",
  65223. "I3": "input",
  65224. "O": "output"
  65225. },
  65226. "connections": {
  65227. "I0": [ "0" ],
  65228. "I1": [ 1174 ],
  65229. "I2": [ 1034 ],
  65230. "I3": [ 2985 ],
  65231. "O": [ 2981 ]
  65232. }
  65233. },
  65234. "cpu_I._zz_31__SB_LUT4_O_31_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  65235. "hide_name": 0,
  65236. "type": "SB_LUT4",
  65237. "parameters": {
  65238. "LUT_INIT": "0001001101011111"
  65239. },
  65240. "attributes": {
  65241. "module_not_derived": "00000000000000000000000000000001",
  65242. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65243. },
  65244. "port_directions": {
  65245. "I0": "input",
  65246. "I1": "input",
  65247. "I2": "input",
  65248. "I3": "input",
  65249. "O": "output"
  65250. },
  65251. "connections": {
  65252. "I0": [ 1109 ],
  65253. "I1": [ 1037 ],
  65254. "I2": [ 1043 ],
  65255. "I3": [ 2986 ],
  65256. "O": [ 2985 ]
  65257. }
  65258. },
  65259. "cpu_I._zz_31__SB_LUT4_O_31_I1_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  65260. "hide_name": 0,
  65261. "type": "SB_DFFER",
  65262. "parameters": {
  65263. },
  65264. "attributes": {
  65265. "module_not_derived": "00000000000000000000000000000001",
  65266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  65267. },
  65268. "port_directions": {
  65269. "C": "input",
  65270. "D": "input",
  65271. "E": "input",
  65272. "Q": "output",
  65273. "R": "input"
  65274. },
  65275. "connections": {
  65276. "C": [ 42 ],
  65277. "D": [ 1225 ],
  65278. "E": [ 1040 ],
  65279. "Q": [ 2986 ],
  65280. "R": [ 127 ]
  65281. }
  65282. },
  65283. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O": {
  65284. "hide_name": 0,
  65285. "type": "SB_LUT4",
  65286. "parameters": {
  65287. "LUT_INIT": "0000000000001100"
  65288. },
  65289. "attributes": {
  65290. "module_not_derived": "00000000000000000000000000000001",
  65291. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65292. },
  65293. "port_directions": {
  65294. "I0": "input",
  65295. "I1": "input",
  65296. "I2": "input",
  65297. "I3": "input",
  65298. "O": "output"
  65299. },
  65300. "connections": {
  65301. "I0": [ "0" ],
  65302. "I1": [ 1246 ],
  65303. "I2": [ 1247 ],
  65304. "I3": [ 2987 ],
  65305. "O": [ 2982 ]
  65306. }
  65307. },
  65308. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1": {
  65309. "hide_name": 0,
  65310. "type": "SB_LUT4",
  65311. "parameters": {
  65312. "LUT_INIT": "1100010010000000"
  65313. },
  65314. "attributes": {
  65315. "module_not_derived": "00000000000000000000000000000001",
  65316. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65317. },
  65318. "port_directions": {
  65319. "I0": "input",
  65320. "I1": "input",
  65321. "I2": "input",
  65322. "I3": "input",
  65323. "O": "output"
  65324. },
  65325. "connections": {
  65326. "I0": [ 1254 ],
  65327. "I1": [ 1242 ],
  65328. "I2": [ 2471 ],
  65329. "I3": [ 2988 ],
  65330. "O": [ 2983 ]
  65331. }
  65332. },
  65333. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I1_SB_LUT4_O": {
  65334. "hide_name": 0,
  65335. "type": "SB_LUT4",
  65336. "parameters": {
  65337. "LUT_INIT": "1111000000001111"
  65338. },
  65339. "attributes": {
  65340. "module_not_derived": "00000000000000000000000000000001",
  65341. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  65342. },
  65343. "port_directions": {
  65344. "I0": "input",
  65345. "I1": "input",
  65346. "I2": "input",
  65347. "I3": "input",
  65348. "O": "output"
  65349. },
  65350. "connections": {
  65351. "I0": [ "0" ],
  65352. "I1": [ "0" ],
  65353. "I2": [ 1246 ],
  65354. "I3": [ 1247 ],
  65355. "O": [ 1242 ]
  65356. }
  65357. },
  65358. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  65359. "hide_name": 0,
  65360. "type": "SB_LUT4",
  65361. "parameters": {
  65362. "LUT_INIT": "0110100110010110"
  65363. },
  65364. "attributes": {
  65365. "module_not_derived": "00000000000000000000000000000001",
  65366. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65367. },
  65368. "port_directions": {
  65369. "I0": "input",
  65370. "I1": "input",
  65371. "I2": "input",
  65372. "I3": "input",
  65373. "O": "output"
  65374. },
  65375. "connections": {
  65376. "I0": [ "0" ],
  65377. "I1": [ 2471 ],
  65378. "I2": [ 2989 ],
  65379. "I3": [ 2990 ],
  65380. "O": [ 2988 ]
  65381. }
  65382. },
  65383. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  65384. "hide_name": 0,
  65385. "type": "SB_LUT4",
  65386. "parameters": {
  65387. "LUT_INIT": "1111000000001111"
  65388. },
  65389. "attributes": {
  65390. "module_not_derived": "00000000000000000000000000000001",
  65391. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  65392. },
  65393. "port_directions": {
  65394. "I0": "input",
  65395. "I1": "input",
  65396. "I2": "input",
  65397. "I3": "input",
  65398. "O": "output"
  65399. },
  65400. "connections": {
  65401. "I0": [ "0" ],
  65402. "I1": [ "0" ],
  65403. "I2": [ 2991 ],
  65404. "I3": [ 2992 ],
  65405. "O": [ 2989 ]
  65406. }
  65407. },
  65408. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  65409. "hide_name": 0,
  65410. "type": "SB_LUT4",
  65411. "parameters": {
  65412. "LUT_INIT": "0010111110010010"
  65413. },
  65414. "attributes": {
  65415. "module_not_derived": "00000000000000000000000000000001",
  65416. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65417. },
  65418. "port_directions": {
  65419. "I0": "input",
  65420. "I1": "input",
  65421. "I2": "input",
  65422. "I3": "input",
  65423. "O": "output"
  65424. },
  65425. "connections": {
  65426. "I0": [ 966 ],
  65427. "I1": [ 1250 ],
  65428. "I2": [ 2471 ],
  65429. "I3": [ 2992 ],
  65430. "O": [ 2987 ]
  65431. }
  65432. },
  65433. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3": {
  65434. "hide_name": 0,
  65435. "type": "SB_LUT4",
  65436. "parameters": {
  65437. "LUT_INIT": "1111000000001111"
  65438. },
  65439. "attributes": {
  65440. "module_not_derived": "00000000000000000000000000000001",
  65441. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  65442. },
  65443. "port_directions": {
  65444. "I0": "input",
  65445. "I1": "input",
  65446. "I2": "input",
  65447. "I3": "input",
  65448. "O": "output"
  65449. },
  65450. "connections": {
  65451. "I0": [ "0" ],
  65452. "I1": [ "0" ],
  65453. "I2": [ 2471 ],
  65454. "I3": [ 2992 ],
  65455. "O": [ 2993 ]
  65456. }
  65457. },
  65458. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  65459. "hide_name": 0,
  65460. "type": "SB_LUT4",
  65461. "parameters": {
  65462. "LUT_INIT": "0011111100000000"
  65463. },
  65464. "attributes": {
  65465. "module_not_derived": "00000000000000000000000000000001",
  65466. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65467. },
  65468. "port_directions": {
  65469. "I0": "input",
  65470. "I1": "input",
  65471. "I2": "input",
  65472. "I3": "input",
  65473. "O": "output"
  65474. },
  65475. "connections": {
  65476. "I0": [ "0" ],
  65477. "I1": [ 2994 ],
  65478. "I2": [ 2868 ],
  65479. "I3": [ 2995 ],
  65480. "O": [ 2992 ]
  65481. }
  65482. },
  65483. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  65484. "hide_name": 0,
  65485. "type": "SB_LUT4",
  65486. "parameters": {
  65487. "LUT_INIT": "1111010101010011"
  65488. },
  65489. "attributes": {
  65490. "module_not_derived": "00000000000000000000000000000001",
  65491. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65492. },
  65493. "port_directions": {
  65494. "I0": "input",
  65495. "I1": "input",
  65496. "I2": "input",
  65497. "I3": "input",
  65498. "O": "output"
  65499. },
  65500. "connections": {
  65501. "I0": [ 943 ],
  65502. "I1": [ 2996 ],
  65503. "I2": [ 2871 ],
  65504. "I3": [ 2872 ],
  65505. "O": [ 2995 ]
  65506. }
  65507. },
  65508. "cpu_I._zz_31__SB_LUT4_O_3_I2_SB_LUT4_O": {
  65509. "hide_name": 0,
  65510. "type": "SB_LUT4",
  65511. "parameters": {
  65512. "LUT_INIT": "0011111100000000"
  65513. },
  65514. "attributes": {
  65515. "module_not_derived": "00000000000000000000000000000001",
  65516. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65517. },
  65518. "port_directions": {
  65519. "I0": "input",
  65520. "I1": "input",
  65521. "I2": "input",
  65522. "I3": "input",
  65523. "O": "output"
  65524. },
  65525. "connections": {
  65526. "I0": [ "0" ],
  65527. "I1": [ 1172 ],
  65528. "I2": [ 1034 ],
  65529. "I3": [ 2997 ],
  65530. "O": [ 2974 ]
  65531. }
  65532. },
  65533. "cpu_I._zz_31__SB_LUT4_O_3_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  65534. "hide_name": 0,
  65535. "type": "SB_LUT4",
  65536. "parameters": {
  65537. "LUT_INIT": "0001001101011111"
  65538. },
  65539. "attributes": {
  65540. "module_not_derived": "00000000000000000000000000000001",
  65541. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65542. },
  65543. "port_directions": {
  65544. "I0": "input",
  65545. "I1": "input",
  65546. "I2": "input",
  65547. "I3": "input",
  65548. "O": "output"
  65549. },
  65550. "connections": {
  65551. "I0": [ 1104 ],
  65552. "I1": [ 1037 ],
  65553. "I2": [ 1043 ],
  65554. "I3": [ 2998 ],
  65555. "O": [ 2997 ]
  65556. }
  65557. },
  65558. "cpu_I._zz_31__SB_LUT4_O_3_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  65559. "hide_name": 0,
  65560. "type": "SB_DFFER",
  65561. "parameters": {
  65562. },
  65563. "attributes": {
  65564. "module_not_derived": "00000000000000000000000000000001",
  65565. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  65566. },
  65567. "port_directions": {
  65568. "C": "input",
  65569. "D": "input",
  65570. "E": "input",
  65571. "Q": "output",
  65572. "R": "input"
  65573. },
  65574. "connections": {
  65575. "C": [ 42 ],
  65576. "D": [ 1220 ],
  65577. "E": [ 1040 ],
  65578. "Q": [ 2998 ],
  65579. "R": [ 127 ]
  65580. }
  65581. },
  65582. "cpu_I._zz_31__SB_LUT4_O_3_I3_SB_LUT4_O": {
  65583. "hide_name": 0,
  65584. "type": "SB_LUT4",
  65585. "parameters": {
  65586. "LUT_INIT": "0110010011111101"
  65587. },
  65588. "attributes": {
  65589. "module_not_derived": "00000000000000000000000000000001",
  65590. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65591. },
  65592. "port_directions": {
  65593. "I0": "input",
  65594. "I1": "input",
  65595. "I2": "input",
  65596. "I3": "input",
  65597. "O": "output"
  65598. },
  65599. "connections": {
  65600. "I0": [ 1246 ],
  65601. "I1": [ 1247 ],
  65602. "I2": [ 2999 ],
  65603. "I3": [ 3000 ],
  65604. "O": [ 2975 ]
  65605. }
  65606. },
  65607. "cpu_I._zz_31__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  65608. "hide_name": 0,
  65609. "type": "SB_LUT4",
  65610. "parameters": {
  65611. "LUT_INIT": "0010111110010010"
  65612. },
  65613. "attributes": {
  65614. "module_not_derived": "00000000000000000000000000000001",
  65615. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65616. },
  65617. "port_directions": {
  65618. "I0": "input",
  65619. "I1": "input",
  65620. "I2": "input",
  65621. "I3": "input",
  65622. "O": "output"
  65623. },
  65624. "connections": {
  65625. "I0": [ 966 ],
  65626. "I1": [ 1250 ],
  65627. "I2": [ 2380 ],
  65628. "I3": [ 2344 ],
  65629. "O": [ 2999 ]
  65630. }
  65631. },
  65632. "cpu_I._zz_31__SB_LUT4_O_4": {
  65633. "hide_name": 0,
  65634. "type": "SB_LUT4",
  65635. "parameters": {
  65636. "LUT_INIT": "0000110000111111"
  65637. },
  65638. "attributes": {
  65639. "module_not_derived": "00000000000000000000000000000001",
  65640. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65641. },
  65642. "port_directions": {
  65643. "I0": "input",
  65644. "I1": "input",
  65645. "I2": "input",
  65646. "I3": "input",
  65647. "O": "output"
  65648. },
  65649. "connections": {
  65650. "I0": [ "0" ],
  65651. "I1": [ 2858 ],
  65652. "I2": [ 3001 ],
  65653. "I3": [ 3002 ],
  65654. "O": [ 3003 ]
  65655. }
  65656. },
  65657. "cpu_I._zz_31__SB_LUT4_O_4_I2_SB_LUT4_O": {
  65658. "hide_name": 0,
  65659. "type": "SB_LUT4",
  65660. "parameters": {
  65661. "LUT_INIT": "0011111100000000"
  65662. },
  65663. "attributes": {
  65664. "module_not_derived": "00000000000000000000000000000001",
  65665. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65666. },
  65667. "port_directions": {
  65668. "I0": "input",
  65669. "I1": "input",
  65670. "I2": "input",
  65671. "I3": "input",
  65672. "O": "output"
  65673. },
  65674. "connections": {
  65675. "I0": [ "0" ],
  65676. "I1": [ 1171 ],
  65677. "I2": [ 1034 ],
  65678. "I3": [ 3004 ],
  65679. "O": [ 3001 ]
  65680. }
  65681. },
  65682. "cpu_I._zz_31__SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  65683. "hide_name": 0,
  65684. "type": "SB_LUT4",
  65685. "parameters": {
  65686. "LUT_INIT": "0001001101011111"
  65687. },
  65688. "attributes": {
  65689. "module_not_derived": "00000000000000000000000000000001",
  65690. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65691. },
  65692. "port_directions": {
  65693. "I0": "input",
  65694. "I1": "input",
  65695. "I2": "input",
  65696. "I3": "input",
  65697. "O": "output"
  65698. },
  65699. "connections": {
  65700. "I0": [ 1102 ],
  65701. "I1": [ 1037 ],
  65702. "I2": [ 1043 ],
  65703. "I3": [ 3005 ],
  65704. "O": [ 3004 ]
  65705. }
  65706. },
  65707. "cpu_I._zz_31__SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  65708. "hide_name": 0,
  65709. "type": "SB_DFFER",
  65710. "parameters": {
  65711. },
  65712. "attributes": {
  65713. "module_not_derived": "00000000000000000000000000000001",
  65714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  65715. },
  65716. "port_directions": {
  65717. "C": "input",
  65718. "D": "input",
  65719. "E": "input",
  65720. "Q": "output",
  65721. "R": "input"
  65722. },
  65723. "connections": {
  65724. "C": [ 42 ],
  65725. "D": [ 1218 ],
  65726. "E": [ 1040 ],
  65727. "Q": [ 3005 ],
  65728. "R": [ 127 ]
  65729. }
  65730. },
  65731. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O": {
  65732. "hide_name": 0,
  65733. "type": "SB_LUT4",
  65734. "parameters": {
  65735. "LUT_INIT": "0110010011111101"
  65736. },
  65737. "attributes": {
  65738. "module_not_derived": "00000000000000000000000000000001",
  65739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65740. },
  65741. "port_directions": {
  65742. "I0": "input",
  65743. "I1": "input",
  65744. "I2": "input",
  65745. "I3": "input",
  65746. "O": "output"
  65747. },
  65748. "connections": {
  65749. "I0": [ 1246 ],
  65750. "I1": [ 1247 ],
  65751. "I2": [ 3006 ],
  65752. "I3": [ 3007 ],
  65753. "O": [ 3002 ]
  65754. }
  65755. },
  65756. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  65757. "hide_name": 0,
  65758. "type": "SB_LUT4",
  65759. "parameters": {
  65760. "LUT_INIT": "0010111110010010"
  65761. },
  65762. "attributes": {
  65763. "module_not_derived": "00000000000000000000000000000001",
  65764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65765. },
  65766. "port_directions": {
  65767. "I0": "input",
  65768. "I1": "input",
  65769. "I2": "input",
  65770. "I3": "input",
  65771. "O": "output"
  65772. },
  65773. "connections": {
  65774. "I0": [ 966 ],
  65775. "I1": [ 1250 ],
  65776. "I2": [ 2383 ],
  65777. "I3": [ 3008 ],
  65778. "O": [ 3006 ]
  65779. }
  65780. },
  65781. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  65782. "hide_name": 0,
  65783. "type": "SB_LUT4",
  65784. "parameters": {
  65785. "LUT_INIT": "0001001001001000"
  65786. },
  65787. "attributes": {
  65788. "module_not_derived": "00000000000000000000000000000001",
  65789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65790. },
  65791. "port_directions": {
  65792. "I0": "input",
  65793. "I1": "input",
  65794. "I2": "input",
  65795. "I3": "input",
  65796. "O": "output"
  65797. },
  65798. "connections": {
  65799. "I0": [ 2399 ],
  65800. "I1": [ 2383 ],
  65801. "I2": [ 2866 ],
  65802. "I3": [ 3008 ],
  65803. "O": [ 3009 ]
  65804. }
  65805. },
  65806. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  65807. "hide_name": 0,
  65808. "type": "SB_LUT4",
  65809. "parameters": {
  65810. "LUT_INIT": "0000000000000001"
  65811. },
  65812. "attributes": {
  65813. "module_not_derived": "00000000000000000000000000000001",
  65814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65815. },
  65816. "port_directions": {
  65817. "I0": "input",
  65818. "I1": "input",
  65819. "I2": "input",
  65820. "I3": "input",
  65821. "O": "output"
  65822. },
  65823. "connections": {
  65824. "I0": [ 3010 ],
  65825. "I1": [ 3011 ],
  65826. "I2": [ 2910 ],
  65827. "I3": [ 3012 ],
  65828. "O": [ 3013 ]
  65829. }
  65830. },
  65831. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  65832. "hide_name": 0,
  65833. "type": "SB_LUT4",
  65834. "parameters": {
  65835. "LUT_INIT": "0011111100000000"
  65836. },
  65837. "attributes": {
  65838. "module_not_derived": "00000000000000000000000000000001",
  65839. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65840. },
  65841. "port_directions": {
  65842. "I0": "input",
  65843. "I1": "input",
  65844. "I2": "input",
  65845. "I3": "input",
  65846. "O": "output"
  65847. },
  65848. "connections": {
  65849. "I0": [ "0" ],
  65850. "I1": [ 3014 ],
  65851. "I2": [ 2868 ],
  65852. "I3": [ 3015 ],
  65853. "O": [ 3008 ]
  65854. }
  65855. },
  65856. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  65857. "hide_name": 0,
  65858. "type": "SB_LUT4",
  65859. "parameters": {
  65860. "LUT_INIT": "1111010101010011"
  65861. },
  65862. "attributes": {
  65863. "module_not_derived": "00000000000000000000000000000001",
  65864. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65865. },
  65866. "port_directions": {
  65867. "I0": "input",
  65868. "I1": "input",
  65869. "I2": "input",
  65870. "I3": "input",
  65871. "O": "output"
  65872. },
  65873. "connections": {
  65874. "I0": [ 943 ],
  65875. "I1": [ 3016 ],
  65876. "I2": [ 2871 ],
  65877. "I3": [ 2872 ],
  65878. "O": [ 3017 ]
  65879. }
  65880. },
  65881. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_1": {
  65882. "hide_name": 0,
  65883. "type": "SB_LUT4",
  65884. "parameters": {
  65885. "LUT_INIT": "1111000000000000"
  65886. },
  65887. "attributes": {
  65888. "module_not_derived": "00000000000000000000000000000001",
  65889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  65890. },
  65891. "port_directions": {
  65892. "I0": "input",
  65893. "I1": "input",
  65894. "I2": "input",
  65895. "I3": "input",
  65896. "O": "output"
  65897. },
  65898. "connections": {
  65899. "I0": [ "0" ],
  65900. "I1": [ "0" ],
  65901. "I2": [ 2871 ],
  65902. "I3": [ 2872 ],
  65903. "O": [ 2868 ]
  65904. }
  65905. },
  65906. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3": {
  65907. "hide_name": 0,
  65908. "type": "SB_LUT4",
  65909. "parameters": {
  65910. "LUT_INIT": "0110110000110011"
  65911. },
  65912. "attributes": {
  65913. "module_not_derived": "00000000000000000000000000000001",
  65914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65915. },
  65916. "port_directions": {
  65917. "I0": "input",
  65918. "I1": "input",
  65919. "I2": "input",
  65920. "I3": "input",
  65921. "O": "output"
  65922. },
  65923. "connections": {
  65924. "I0": [ 3014 ],
  65925. "I1": [ 2991 ],
  65926. "I2": [ 2868 ],
  65927. "I3": [ 3015 ],
  65928. "O": [ 3018 ]
  65929. }
  65930. },
  65931. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_CARRY_CO": {
  65932. "hide_name": 0,
  65933. "type": "SB_CARRY",
  65934. "parameters": {
  65935. },
  65936. "attributes": {
  65937. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  65938. },
  65939. "port_directions": {
  65940. "CI": "input",
  65941. "CO": "output",
  65942. "I0": "input",
  65943. "I1": "input"
  65944. },
  65945. "connections": {
  65946. "CI": [ 3019 ],
  65947. "CO": [ 3020 ],
  65948. "I0": [ 2380 ],
  65949. "I1": [ 3021 ]
  65950. }
  65951. },
  65952. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  65953. "hide_name": 0,
  65954. "type": "SB_LUT4",
  65955. "parameters": {
  65956. "LUT_INIT": "1111010101010011"
  65957. },
  65958. "attributes": {
  65959. "module_not_derived": "00000000000000000000000000000001",
  65960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  65961. },
  65962. "port_directions": {
  65963. "I0": "input",
  65964. "I1": "input",
  65965. "I2": "input",
  65966. "I3": "input",
  65967. "O": "output"
  65968. },
  65969. "connections": {
  65970. "I0": [ 1000 ],
  65971. "I1": [ 3022 ],
  65972. "I2": [ 2871 ],
  65973. "I3": [ 2872 ],
  65974. "O": [ 3015 ]
  65975. }
  65976. },
  65977. "cpu_I._zz_31__SB_LUT4_O_5": {
  65978. "hide_name": 0,
  65979. "type": "SB_LUT4",
  65980. "parameters": {
  65981. "LUT_INIT": "0000110000111111"
  65982. },
  65983. "attributes": {
  65984. "module_not_derived": "00000000000000000000000000000001",
  65985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  65986. },
  65987. "port_directions": {
  65988. "I0": "input",
  65989. "I1": "input",
  65990. "I2": "input",
  65991. "I3": "input",
  65992. "O": "output"
  65993. },
  65994. "connections": {
  65995. "I0": [ "0" ],
  65996. "I1": [ 2858 ],
  65997. "I2": [ 3023 ],
  65998. "I3": [ 3024 ],
  65999. "O": [ 3025 ]
  66000. }
  66001. },
  66002. "cpu_I._zz_31__SB_LUT4_O_5_I2_SB_LUT4_O": {
  66003. "hide_name": 0,
  66004. "type": "SB_LUT4",
  66005. "parameters": {
  66006. "LUT_INIT": "0011111100000000"
  66007. },
  66008. "attributes": {
  66009. "module_not_derived": "00000000000000000000000000000001",
  66010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66011. },
  66012. "port_directions": {
  66013. "I0": "input",
  66014. "I1": "input",
  66015. "I2": "input",
  66016. "I3": "input",
  66017. "O": "output"
  66018. },
  66019. "connections": {
  66020. "I0": [ "0" ],
  66021. "I1": [ 1170 ],
  66022. "I2": [ 1034 ],
  66023. "I3": [ 3026 ],
  66024. "O": [ 3023 ]
  66025. }
  66026. },
  66027. "cpu_I._zz_31__SB_LUT4_O_5_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66028. "hide_name": 0,
  66029. "type": "SB_LUT4",
  66030. "parameters": {
  66031. "LUT_INIT": "0001001101011111"
  66032. },
  66033. "attributes": {
  66034. "module_not_derived": "00000000000000000000000000000001",
  66035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66036. },
  66037. "port_directions": {
  66038. "I0": "input",
  66039. "I1": "input",
  66040. "I2": "input",
  66041. "I3": "input",
  66042. "O": "output"
  66043. },
  66044. "connections": {
  66045. "I0": [ 1100 ],
  66046. "I1": [ 1037 ],
  66047. "I2": [ 1043 ],
  66048. "I3": [ 3027 ],
  66049. "O": [ 3026 ]
  66050. }
  66051. },
  66052. "cpu_I._zz_31__SB_LUT4_O_5_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  66053. "hide_name": 0,
  66054. "type": "SB_DFFER",
  66055. "parameters": {
  66056. },
  66057. "attributes": {
  66058. "module_not_derived": "00000000000000000000000000000001",
  66059. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  66060. },
  66061. "port_directions": {
  66062. "C": "input",
  66063. "D": "input",
  66064. "E": "input",
  66065. "Q": "output",
  66066. "R": "input"
  66067. },
  66068. "connections": {
  66069. "C": [ 42 ],
  66070. "D": [ 1216 ],
  66071. "E": [ 1040 ],
  66072. "Q": [ 3027 ],
  66073. "R": [ 127 ]
  66074. }
  66075. },
  66076. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O": {
  66077. "hide_name": 0,
  66078. "type": "SB_LUT4",
  66079. "parameters": {
  66080. "LUT_INIT": "0110010011111101"
  66081. },
  66082. "attributes": {
  66083. "module_not_derived": "00000000000000000000000000000001",
  66084. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66085. },
  66086. "port_directions": {
  66087. "I0": "input",
  66088. "I1": "input",
  66089. "I2": "input",
  66090. "I3": "input",
  66091. "O": "output"
  66092. },
  66093. "connections": {
  66094. "I0": [ 1246 ],
  66095. "I1": [ 1247 ],
  66096. "I2": [ 3028 ],
  66097. "I3": [ 3029 ],
  66098. "O": [ 3024 ]
  66099. }
  66100. },
  66101. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  66102. "hide_name": 0,
  66103. "type": "SB_LUT4",
  66104. "parameters": {
  66105. "LUT_INIT": "0010111110010010"
  66106. },
  66107. "attributes": {
  66108. "module_not_derived": "00000000000000000000000000000001",
  66109. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66110. },
  66111. "port_directions": {
  66112. "I0": "input",
  66113. "I1": "input",
  66114. "I2": "input",
  66115. "I3": "input",
  66116. "O": "output"
  66117. },
  66118. "connections": {
  66119. "I0": [ 966 ],
  66120. "I1": [ 1250 ],
  66121. "I2": [ 2385 ],
  66122. "I3": [ 3030 ],
  66123. "O": [ 3028 ]
  66124. }
  66125. },
  66126. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  66127. "hide_name": 0,
  66128. "type": "SB_LUT4",
  66129. "parameters": {
  66130. "LUT_INIT": "1111000000001111"
  66131. },
  66132. "attributes": {
  66133. "module_not_derived": "00000000000000000000000000000001",
  66134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  66135. },
  66136. "port_directions": {
  66137. "I0": "input",
  66138. "I1": "input",
  66139. "I2": "input",
  66140. "I3": "input",
  66141. "O": "output"
  66142. },
  66143. "connections": {
  66144. "I0": [ "0" ],
  66145. "I1": [ "0" ],
  66146. "I2": [ 2991 ],
  66147. "I3": [ 3030 ],
  66148. "O": [ 3031 ]
  66149. }
  66150. },
  66151. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  66152. "hide_name": 0,
  66153. "type": "SB_LUT4",
  66154. "parameters": {
  66155. "LUT_INIT": "1111000000001111"
  66156. },
  66157. "attributes": {
  66158. "module_not_derived": "00000000000000000000000000000001",
  66159. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  66160. },
  66161. "port_directions": {
  66162. "I0": "input",
  66163. "I1": "input",
  66164. "I2": "input",
  66165. "I3": "input",
  66166. "O": "output"
  66167. },
  66168. "connections": {
  66169. "I0": [ "0" ],
  66170. "I1": [ "0" ],
  66171. "I2": [ 2385 ],
  66172. "I3": [ 3030 ],
  66173. "O": [ 3032 ]
  66174. }
  66175. },
  66176. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_CARRY_CO": {
  66177. "hide_name": 0,
  66178. "type": "SB_CARRY",
  66179. "parameters": {
  66180. },
  66181. "attributes": {
  66182. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  66183. },
  66184. "port_directions": {
  66185. "CI": "input",
  66186. "CO": "output",
  66187. "I0": "input",
  66188. "I1": "input"
  66189. },
  66190. "connections": {
  66191. "CI": [ 3020 ],
  66192. "CO": [ 3033 ],
  66193. "I0": [ 2383 ],
  66194. "I1": [ 3018 ]
  66195. }
  66196. },
  66197. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66198. "hide_name": 0,
  66199. "type": "SB_LUT4",
  66200. "parameters": {
  66201. "LUT_INIT": "0111111100000000"
  66202. },
  66203. "attributes": {
  66204. "module_not_derived": "00000000000000000000000000000001",
  66205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66206. },
  66207. "port_directions": {
  66208. "I0": "input",
  66209. "I1": "input",
  66210. "I2": "input",
  66211. "I3": "input",
  66212. "O": "output"
  66213. },
  66214. "connections": {
  66215. "I0": [ 3034 ],
  66216. "I1": [ 2871 ],
  66217. "I2": [ 2872 ],
  66218. "I3": [ 3035 ],
  66219. "O": [ 3030 ]
  66220. }
  66221. },
  66222. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  66223. "hide_name": 0,
  66224. "type": "SB_LUT4",
  66225. "parameters": {
  66226. "LUT_INIT": "1111010101010011"
  66227. },
  66228. "attributes": {
  66229. "module_not_derived": "00000000000000000000000000000001",
  66230. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66231. },
  66232. "port_directions": {
  66233. "I0": "input",
  66234. "I1": "input",
  66235. "I2": "input",
  66236. "I3": "input",
  66237. "O": "output"
  66238. },
  66239. "connections": {
  66240. "I0": [ 998 ],
  66241. "I1": [ 3036 ],
  66242. "I2": [ 2871 ],
  66243. "I3": [ 2872 ],
  66244. "O": [ 3035 ]
  66245. }
  66246. },
  66247. "cpu_I._zz_31__SB_LUT4_O_6": {
  66248. "hide_name": 0,
  66249. "type": "SB_LUT4",
  66250. "parameters": {
  66251. "LUT_INIT": "0000110000111111"
  66252. },
  66253. "attributes": {
  66254. "module_not_derived": "00000000000000000000000000000001",
  66255. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66256. },
  66257. "port_directions": {
  66258. "I0": "input",
  66259. "I1": "input",
  66260. "I2": "input",
  66261. "I3": "input",
  66262. "O": "output"
  66263. },
  66264. "connections": {
  66265. "I0": [ "0" ],
  66266. "I1": [ 2858 ],
  66267. "I2": [ 2844 ],
  66268. "I3": [ 3037 ],
  66269. "O": [ 3038 ]
  66270. }
  66271. },
  66272. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O": {
  66273. "hide_name": 0,
  66274. "type": "SB_LUT4",
  66275. "parameters": {
  66276. "LUT_INIT": "0110010011111101"
  66277. },
  66278. "attributes": {
  66279. "module_not_derived": "00000000000000000000000000000001",
  66280. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66281. },
  66282. "port_directions": {
  66283. "I0": "input",
  66284. "I1": "input",
  66285. "I2": "input",
  66286. "I3": "input",
  66287. "O": "output"
  66288. },
  66289. "connections": {
  66290. "I0": [ 1246 ],
  66291. "I1": [ 1247 ],
  66292. "I2": [ 3039 ],
  66293. "I3": [ 3040 ],
  66294. "O": [ 3037 ]
  66295. }
  66296. },
  66297. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  66298. "hide_name": 0,
  66299. "type": "SB_LUT4",
  66300. "parameters": {
  66301. "LUT_INIT": "0010111110010010"
  66302. },
  66303. "attributes": {
  66304. "module_not_derived": "00000000000000000000000000000001",
  66305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66306. },
  66307. "port_directions": {
  66308. "I0": "input",
  66309. "I1": "input",
  66310. "I2": "input",
  66311. "I3": "input",
  66312. "O": "output"
  66313. },
  66314. "connections": {
  66315. "I0": [ 966 ],
  66316. "I1": [ 1250 ],
  66317. "I2": [ 2387 ],
  66318. "I3": [ 3041 ],
  66319. "O": [ 3039 ]
  66320. }
  66321. },
  66322. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I2": {
  66323. "hide_name": 0,
  66324. "type": "SB_LUT4",
  66325. "parameters": {
  66326. "LUT_INIT": "0001010000101000"
  66327. },
  66328. "attributes": {
  66329. "module_not_derived": "00000000000000000000000000000001",
  66330. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66331. },
  66332. "port_directions": {
  66333. "I0": "input",
  66334. "I1": "input",
  66335. "I2": "input",
  66336. "I3": "input",
  66337. "O": "output"
  66338. },
  66339. "connections": {
  66340. "I0": [ 2380 ],
  66341. "I1": [ 2387 ],
  66342. "I2": [ 3041 ],
  66343. "I3": [ 2344 ],
  66344. "O": [ 3042 ]
  66345. }
  66346. },
  66347. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  66348. "hide_name": 0,
  66349. "type": "SB_LUT4",
  66350. "parameters": {
  66351. "LUT_INIT": "1111000000001111"
  66352. },
  66353. "attributes": {
  66354. "module_not_derived": "00000000000000000000000000000001",
  66355. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  66356. },
  66357. "port_directions": {
  66358. "I0": "input",
  66359. "I1": "input",
  66360. "I2": "input",
  66361. "I3": "input",
  66362. "O": "output"
  66363. },
  66364. "connections": {
  66365. "I0": [ "0" ],
  66366. "I1": [ "0" ],
  66367. "I2": [ 2991 ],
  66368. "I3": [ 3041 ],
  66369. "O": [ 3043 ]
  66370. }
  66371. },
  66372. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_CARRY_CO": {
  66373. "hide_name": 0,
  66374. "type": "SB_CARRY",
  66375. "parameters": {
  66376. },
  66377. "attributes": {
  66378. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  66379. },
  66380. "port_directions": {
  66381. "CI": "input",
  66382. "CO": "output",
  66383. "I0": "input",
  66384. "I1": "input"
  66385. },
  66386. "connections": {
  66387. "CI": [ 3033 ],
  66388. "CO": [ 3044 ],
  66389. "I0": [ 2385 ],
  66390. "I1": [ 3031 ]
  66391. }
  66392. },
  66393. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66394. "hide_name": 0,
  66395. "type": "SB_LUT4",
  66396. "parameters": {
  66397. "LUT_INIT": "0011111100000000"
  66398. },
  66399. "attributes": {
  66400. "module_not_derived": "00000000000000000000000000000001",
  66401. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66402. },
  66403. "port_directions": {
  66404. "I0": "input",
  66405. "I1": "input",
  66406. "I2": "input",
  66407. "I3": "input",
  66408. "O": "output"
  66409. },
  66410. "connections": {
  66411. "I0": [ "0" ],
  66412. "I1": [ 3045 ],
  66413. "I2": [ 2868 ],
  66414. "I3": [ 3046 ],
  66415. "O": [ 3041 ]
  66416. }
  66417. },
  66418. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  66419. "hide_name": 0,
  66420. "type": "SB_LUT4",
  66421. "parameters": {
  66422. "LUT_INIT": "1111010101010011"
  66423. },
  66424. "attributes": {
  66425. "module_not_derived": "00000000000000000000000000000001",
  66426. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66427. },
  66428. "port_directions": {
  66429. "I0": "input",
  66430. "I1": "input",
  66431. "I2": "input",
  66432. "I3": "input",
  66433. "O": "output"
  66434. },
  66435. "connections": {
  66436. "I0": [ 996 ],
  66437. "I1": [ 3047 ],
  66438. "I2": [ 2871 ],
  66439. "I3": [ 2872 ],
  66440. "O": [ 3046 ]
  66441. }
  66442. },
  66443. "cpu_I._zz_31__SB_LUT4_O_7": {
  66444. "hide_name": 0,
  66445. "type": "SB_LUT4",
  66446. "parameters": {
  66447. "LUT_INIT": "0000110000111111"
  66448. },
  66449. "attributes": {
  66450. "module_not_derived": "00000000000000000000000000000001",
  66451. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66452. },
  66453. "port_directions": {
  66454. "I0": "input",
  66455. "I1": "input",
  66456. "I2": "input",
  66457. "I3": "input",
  66458. "O": "output"
  66459. },
  66460. "connections": {
  66461. "I0": [ "0" ],
  66462. "I1": [ 2858 ],
  66463. "I2": [ 3048 ],
  66464. "I3": [ 3049 ],
  66465. "O": [ 3050 ]
  66466. }
  66467. },
  66468. "cpu_I._zz_31__SB_LUT4_O_7_I2_SB_LUT4_O": {
  66469. "hide_name": 0,
  66470. "type": "SB_LUT4",
  66471. "parameters": {
  66472. "LUT_INIT": "0011111100000000"
  66473. },
  66474. "attributes": {
  66475. "module_not_derived": "00000000000000000000000000000001",
  66476. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66477. },
  66478. "port_directions": {
  66479. "I0": "input",
  66480. "I1": "input",
  66481. "I2": "input",
  66482. "I3": "input",
  66483. "O": "output"
  66484. },
  66485. "connections": {
  66486. "I0": [ "0" ],
  66487. "I1": [ 1169 ],
  66488. "I2": [ 1034 ],
  66489. "I3": [ 3051 ],
  66490. "O": [ 3048 ]
  66491. }
  66492. },
  66493. "cpu_I._zz_31__SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66494. "hide_name": 0,
  66495. "type": "SB_LUT4",
  66496. "parameters": {
  66497. "LUT_INIT": "0001001101011111"
  66498. },
  66499. "attributes": {
  66500. "module_not_derived": "00000000000000000000000000000001",
  66501. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66502. },
  66503. "port_directions": {
  66504. "I0": "input",
  66505. "I1": "input",
  66506. "I2": "input",
  66507. "I3": "input",
  66508. "O": "output"
  66509. },
  66510. "connections": {
  66511. "I0": [ 1096 ],
  66512. "I1": [ 1037 ],
  66513. "I2": [ 1043 ],
  66514. "I3": [ 3052 ],
  66515. "O": [ 3051 ]
  66516. }
  66517. },
  66518. "cpu_I._zz_31__SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  66519. "hide_name": 0,
  66520. "type": "SB_DFFER",
  66521. "parameters": {
  66522. },
  66523. "attributes": {
  66524. "module_not_derived": "00000000000000000000000000000001",
  66525. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  66526. },
  66527. "port_directions": {
  66528. "C": "input",
  66529. "D": "input",
  66530. "E": "input",
  66531. "Q": "output",
  66532. "R": "input"
  66533. },
  66534. "connections": {
  66535. "C": [ 42 ],
  66536. "D": [ 1213 ],
  66537. "E": [ 1040 ],
  66538. "Q": [ 3052 ],
  66539. "R": [ 127 ]
  66540. }
  66541. },
  66542. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O": {
  66543. "hide_name": 0,
  66544. "type": "SB_LUT4",
  66545. "parameters": {
  66546. "LUT_INIT": "0110010011111101"
  66547. },
  66548. "attributes": {
  66549. "module_not_derived": "00000000000000000000000000000001",
  66550. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66551. },
  66552. "port_directions": {
  66553. "I0": "input",
  66554. "I1": "input",
  66555. "I2": "input",
  66556. "I3": "input",
  66557. "O": "output"
  66558. },
  66559. "connections": {
  66560. "I0": [ 1246 ],
  66561. "I1": [ 1247 ],
  66562. "I2": [ 3053 ],
  66563. "I3": [ 3054 ],
  66564. "O": [ 3049 ]
  66565. }
  66566. },
  66567. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  66568. "hide_name": 0,
  66569. "type": "SB_LUT4",
  66570. "parameters": {
  66571. "LUT_INIT": "0010111110010010"
  66572. },
  66573. "attributes": {
  66574. "module_not_derived": "00000000000000000000000000000001",
  66575. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66576. },
  66577. "port_directions": {
  66578. "I0": "input",
  66579. "I1": "input",
  66580. "I2": "input",
  66581. "I3": "input",
  66582. "O": "output"
  66583. },
  66584. "connections": {
  66585. "I0": [ 966 ],
  66586. "I1": [ 1250 ],
  66587. "I2": [ 2393 ],
  66588. "I3": [ 3055 ],
  66589. "O": [ 3053 ]
  66590. }
  66591. },
  66592. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I2": {
  66593. "hide_name": 0,
  66594. "type": "SB_LUT4",
  66595. "parameters": {
  66596. "LUT_INIT": "0001010000101000"
  66597. },
  66598. "attributes": {
  66599. "module_not_derived": "00000000000000000000000000000001",
  66600. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66601. },
  66602. "port_directions": {
  66603. "I0": "input",
  66604. "I1": "input",
  66605. "I2": "input",
  66606. "I3": "input",
  66607. "O": "output"
  66608. },
  66609. "connections": {
  66610. "I0": [ 2472 ],
  66611. "I1": [ 2393 ],
  66612. "I2": [ 3055 ],
  66613. "I3": [ 2359 ],
  66614. "O": [ 3056 ]
  66615. }
  66616. },
  66617. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  66618. "hide_name": 0,
  66619. "type": "SB_LUT4",
  66620. "parameters": {
  66621. "LUT_INIT": "1111000000001111"
  66622. },
  66623. "attributes": {
  66624. "module_not_derived": "00000000000000000000000000000001",
  66625. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  66626. },
  66627. "port_directions": {
  66628. "I0": "input",
  66629. "I1": "input",
  66630. "I2": "input",
  66631. "I3": "input",
  66632. "O": "output"
  66633. },
  66634. "connections": {
  66635. "I0": [ "0" ],
  66636. "I1": [ "0" ],
  66637. "I2": [ 2991 ],
  66638. "I3": [ 3055 ],
  66639. "O": [ 3057 ]
  66640. }
  66641. },
  66642. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_CARRY_CO": {
  66643. "hide_name": 0,
  66644. "type": "SB_CARRY",
  66645. "parameters": {
  66646. },
  66647. "attributes": {
  66648. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  66649. },
  66650. "port_directions": {
  66651. "CI": "input",
  66652. "CO": "output",
  66653. "I0": "input",
  66654. "I1": "input"
  66655. },
  66656. "connections": {
  66657. "CI": [ 3044 ],
  66658. "CO": [ 3058 ],
  66659. "I0": [ 2387 ],
  66660. "I1": [ 3043 ]
  66661. }
  66662. },
  66663. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66664. "hide_name": 0,
  66665. "type": "SB_LUT4",
  66666. "parameters": {
  66667. "LUT_INIT": "0011111100000000"
  66668. },
  66669. "attributes": {
  66670. "module_not_derived": "00000000000000000000000000000001",
  66671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66672. },
  66673. "port_directions": {
  66674. "I0": "input",
  66675. "I1": "input",
  66676. "I2": "input",
  66677. "I3": "input",
  66678. "O": "output"
  66679. },
  66680. "connections": {
  66681. "I0": [ "0" ],
  66682. "I1": [ 3059 ],
  66683. "I2": [ 2868 ],
  66684. "I3": [ 3060 ],
  66685. "O": [ 3055 ]
  66686. }
  66687. },
  66688. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  66689. "hide_name": 0,
  66690. "type": "SB_LUT4",
  66691. "parameters": {
  66692. "LUT_INIT": "1111010101010011"
  66693. },
  66694. "attributes": {
  66695. "module_not_derived": "00000000000000000000000000000001",
  66696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66697. },
  66698. "port_directions": {
  66699. "I0": "input",
  66700. "I1": "input",
  66701. "I2": "input",
  66702. "I3": "input",
  66703. "O": "output"
  66704. },
  66705. "connections": {
  66706. "I0": [ 990 ],
  66707. "I1": [ 3061 ],
  66708. "I2": [ 2871 ],
  66709. "I3": [ 2872 ],
  66710. "O": [ 3060 ]
  66711. }
  66712. },
  66713. "cpu_I._zz_31__SB_LUT4_O_8": {
  66714. "hide_name": 0,
  66715. "type": "SB_LUT4",
  66716. "parameters": {
  66717. "LUT_INIT": "0000110000111111"
  66718. },
  66719. "attributes": {
  66720. "module_not_derived": "00000000000000000000000000000001",
  66721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66722. },
  66723. "port_directions": {
  66724. "I0": "input",
  66725. "I1": "input",
  66726. "I2": "input",
  66727. "I3": "input",
  66728. "O": "output"
  66729. },
  66730. "connections": {
  66731. "I0": [ "0" ],
  66732. "I1": [ 2858 ],
  66733. "I2": [ 3062 ],
  66734. "I3": [ 3063 ],
  66735. "O": [ 3064 ]
  66736. }
  66737. },
  66738. "cpu_I._zz_31__SB_LUT4_O_9": {
  66739. "hide_name": 0,
  66740. "type": "SB_LUT4",
  66741. "parameters": {
  66742. "LUT_INIT": "0000110000111111"
  66743. },
  66744. "attributes": {
  66745. "module_not_derived": "00000000000000000000000000000001",
  66746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66747. },
  66748. "port_directions": {
  66749. "I0": "input",
  66750. "I1": "input",
  66751. "I2": "input",
  66752. "I3": "input",
  66753. "O": "output"
  66754. },
  66755. "connections": {
  66756. "I0": [ "0" ],
  66757. "I1": [ 2858 ],
  66758. "I2": [ 3065 ],
  66759. "I3": [ 3066 ],
  66760. "O": [ 3067 ]
  66761. }
  66762. },
  66763. "cpu_I._zz_31__SB_LUT4_O_9_I2_SB_LUT4_O": {
  66764. "hide_name": 0,
  66765. "type": "SB_LUT4",
  66766. "parameters": {
  66767. "LUT_INIT": "0011111100000000"
  66768. },
  66769. "attributes": {
  66770. "module_not_derived": "00000000000000000000000000000001",
  66771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66772. },
  66773. "port_directions": {
  66774. "I0": "input",
  66775. "I1": "input",
  66776. "I2": "input",
  66777. "I3": "input",
  66778. "O": "output"
  66779. },
  66780. "connections": {
  66781. "I0": [ "0" ],
  66782. "I1": [ 1167 ],
  66783. "I2": [ 1034 ],
  66784. "I3": [ 3068 ],
  66785. "O": [ 3065 ]
  66786. }
  66787. },
  66788. "cpu_I._zz_31__SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66789. "hide_name": 0,
  66790. "type": "SB_LUT4",
  66791. "parameters": {
  66792. "LUT_INIT": "0001001101011111"
  66793. },
  66794. "attributes": {
  66795. "module_not_derived": "00000000000000000000000000000001",
  66796. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66797. },
  66798. "port_directions": {
  66799. "I0": "input",
  66800. "I1": "input",
  66801. "I2": "input",
  66802. "I3": "input",
  66803. "O": "output"
  66804. },
  66805. "connections": {
  66806. "I0": [ 1092 ],
  66807. "I1": [ 1037 ],
  66808. "I2": [ 1043 ],
  66809. "I3": [ 3069 ],
  66810. "O": [ 3068 ]
  66811. }
  66812. },
  66813. "cpu_I._zz_31__SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  66814. "hide_name": 0,
  66815. "type": "SB_DFFER",
  66816. "parameters": {
  66817. },
  66818. "attributes": {
  66819. "module_not_derived": "00000000000000000000000000000001",
  66820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  66821. },
  66822. "port_directions": {
  66823. "C": "input",
  66824. "D": "input",
  66825. "E": "input",
  66826. "Q": "output",
  66827. "R": "input"
  66828. },
  66829. "connections": {
  66830. "C": [ 42 ],
  66831. "D": [ 1209 ],
  66832. "E": [ 1040 ],
  66833. "Q": [ 3069 ],
  66834. "R": [ 127 ]
  66835. }
  66836. },
  66837. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O": {
  66838. "hide_name": 0,
  66839. "type": "SB_LUT4",
  66840. "parameters": {
  66841. "LUT_INIT": "0110010011111101"
  66842. },
  66843. "attributes": {
  66844. "module_not_derived": "00000000000000000000000000000001",
  66845. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66846. },
  66847. "port_directions": {
  66848. "I0": "input",
  66849. "I1": "input",
  66850. "I2": "input",
  66851. "I3": "input",
  66852. "O": "output"
  66853. },
  66854. "connections": {
  66855. "I0": [ 1246 ],
  66856. "I1": [ 1247 ],
  66857. "I2": [ 3070 ],
  66858. "I3": [ 3071 ],
  66859. "O": [ 3066 ]
  66860. }
  66861. },
  66862. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  66863. "hide_name": 0,
  66864. "type": "SB_LUT4",
  66865. "parameters": {
  66866. "LUT_INIT": "0010111110010010"
  66867. },
  66868. "attributes": {
  66869. "module_not_derived": "00000000000000000000000000000001",
  66870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66871. },
  66872. "port_directions": {
  66873. "I0": "input",
  66874. "I1": "input",
  66875. "I2": "input",
  66876. "I3": "input",
  66877. "O": "output"
  66878. },
  66879. "connections": {
  66880. "I0": [ 966 ],
  66881. "I1": [ 1250 ],
  66882. "I2": [ 2397 ],
  66883. "I3": [ 3072 ],
  66884. "O": [ 3070 ]
  66885. }
  66886. },
  66887. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  66888. "hide_name": 0,
  66889. "type": "SB_LUT4",
  66890. "parameters": {
  66891. "LUT_INIT": "1111000000001111"
  66892. },
  66893. "attributes": {
  66894. "module_not_derived": "00000000000000000000000000000001",
  66895. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  66896. },
  66897. "port_directions": {
  66898. "I0": "input",
  66899. "I1": "input",
  66900. "I2": "input",
  66901. "I3": "input",
  66902. "O": "output"
  66903. },
  66904. "connections": {
  66905. "I0": [ "0" ],
  66906. "I1": [ "0" ],
  66907. "I2": [ 2397 ],
  66908. "I3": [ 3072 ],
  66909. "O": [ 3010 ]
  66910. }
  66911. },
  66912. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  66913. "hide_name": 0,
  66914. "type": "SB_LUT4",
  66915. "parameters": {
  66916. "LUT_INIT": "1111000000001111"
  66917. },
  66918. "attributes": {
  66919. "module_not_derived": "00000000000000000000000000000001",
  66920. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  66921. },
  66922. "port_directions": {
  66923. "I0": "input",
  66924. "I1": "input",
  66925. "I2": "input",
  66926. "I3": "input",
  66927. "O": "output"
  66928. },
  66929. "connections": {
  66930. "I0": [ "0" ],
  66931. "I1": [ "0" ],
  66932. "I2": [ 2473 ],
  66933. "I3": [ 3073 ],
  66934. "O": [ 3011 ]
  66935. }
  66936. },
  66937. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  66938. "hide_name": 0,
  66939. "type": "SB_LUT4",
  66940. "parameters": {
  66941. "LUT_INIT": "0011111100000000"
  66942. },
  66943. "attributes": {
  66944. "module_not_derived": "00000000000000000000000000000001",
  66945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  66946. },
  66947. "port_directions": {
  66948. "I0": "input",
  66949. "I1": "input",
  66950. "I2": "input",
  66951. "I3": "input",
  66952. "O": "output"
  66953. },
  66954. "connections": {
  66955. "I0": [ "0" ],
  66956. "I1": [ 3074 ],
  66957. "I2": [ 2868 ],
  66958. "I3": [ 3075 ],
  66959. "O": [ 3072 ]
  66960. }
  66961. },
  66962. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  66963. "hide_name": 0,
  66964. "type": "SB_LUT4",
  66965. "parameters": {
  66966. "LUT_INIT": "1111010101010011"
  66967. },
  66968. "attributes": {
  66969. "module_not_derived": "00000000000000000000000000000001",
  66970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66971. },
  66972. "port_directions": {
  66973. "I0": "input",
  66974. "I1": "input",
  66975. "I2": "input",
  66976. "I3": "input",
  66977. "O": "output"
  66978. },
  66979. "connections": {
  66980. "I0": [ 946 ],
  66981. "I1": [ 3076 ],
  66982. "I2": [ 2871 ],
  66983. "I3": [ 2872 ],
  66984. "O": [ 3075 ]
  66985. }
  66986. },
  66987. "cpu_I._zz_31__SB_LUT4_O_I2_SB_LUT4_O": {
  66988. "hide_name": 0,
  66989. "type": "SB_LUT4",
  66990. "parameters": {
  66991. "LUT_INIT": "0001001100000000"
  66992. },
  66993. "attributes": {
  66994. "module_not_derived": "00000000000000000000000000000001",
  66995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  66996. },
  66997. "port_directions": {
  66998. "I0": "input",
  66999. "I1": "input",
  67000. "I2": "input",
  67001. "I3": "input",
  67002. "O": "output"
  67003. },
  67004. "connections": {
  67005. "I0": [ 1037 ],
  67006. "I1": [ 1029 ],
  67007. "I2": [ 2764 ],
  67008. "I3": [ 2765 ],
  67009. "O": [ 2769 ]
  67010. }
  67011. },
  67012. "cpu_I._zz_31__SB_LUT4_O_I3_SB_LUT4_O": {
  67013. "hide_name": 0,
  67014. "type": "SB_LUT4",
  67015. "parameters": {
  67016. "LUT_INIT": "0110010011111101"
  67017. },
  67018. "attributes": {
  67019. "module_not_derived": "00000000000000000000000000000001",
  67020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67021. },
  67022. "port_directions": {
  67023. "I0": "input",
  67024. "I1": "input",
  67025. "I2": "input",
  67026. "I3": "input",
  67027. "O": "output"
  67028. },
  67029. "connections": {
  67030. "I0": [ 1246 ],
  67031. "I1": [ 1247 ],
  67032. "I2": [ 3077 ],
  67033. "I3": [ 3078 ],
  67034. "O": [ 2859 ]
  67035. }
  67036. },
  67037. "cpu_I._zz_31__SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67038. "hide_name": 0,
  67039. "type": "SB_LUT4",
  67040. "parameters": {
  67041. "LUT_INIT": "0010111110010010"
  67042. },
  67043. "attributes": {
  67044. "module_not_derived": "00000000000000000000000000000001",
  67045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67046. },
  67047. "port_directions": {
  67048. "I0": "input",
  67049. "I1": "input",
  67050. "I2": "input",
  67051. "I3": "input",
  67052. "O": "output"
  67053. },
  67054. "connections": {
  67055. "I0": [ 966 ],
  67056. "I1": [ 1250 ],
  67057. "I2": [ 2470 ],
  67058. "I3": [ 2367 ],
  67059. "O": [ 3077 ]
  67060. }
  67061. },
  67062. "cpu_I._zz_32__SB_LUT4_O": {
  67063. "hide_name": 0,
  67064. "type": "SB_LUT4",
  67065. "parameters": {
  67066. "LUT_INIT": "1100000011001111"
  67067. },
  67068. "attributes": {
  67069. "module_not_derived": "00000000000000000000000000000001",
  67070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67071. },
  67072. "port_directions": {
  67073. "I0": "input",
  67074. "I1": "input",
  67075. "I2": "input",
  67076. "I3": "input",
  67077. "O": "output"
  67078. },
  67079. "connections": {
  67080. "I0": [ "0" ],
  67081. "I1": [ 3079 ],
  67082. "I2": [ 3080 ],
  67083. "I3": [ 3081 ],
  67084. "O": [ 3082 ]
  67085. }
  67086. },
  67087. "cpu_I._zz_32__SB_LUT4_O_1": {
  67088. "hide_name": 0,
  67089. "type": "SB_LUT4",
  67090. "parameters": {
  67091. "LUT_INIT": "1100000011001111"
  67092. },
  67093. "attributes": {
  67094. "module_not_derived": "00000000000000000000000000000001",
  67095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67096. },
  67097. "port_directions": {
  67098. "I0": "input",
  67099. "I1": "input",
  67100. "I2": "input",
  67101. "I3": "input",
  67102. "O": "output"
  67103. },
  67104. "connections": {
  67105. "I0": [ "0" ],
  67106. "I1": [ 3083 ],
  67107. "I2": [ 3080 ],
  67108. "I3": [ 3084 ],
  67109. "O": [ 3085 ]
  67110. }
  67111. },
  67112. "cpu_I._zz_32__SB_LUT4_O_10": {
  67113. "hide_name": 0,
  67114. "type": "SB_LUT4",
  67115. "parameters": {
  67116. "LUT_INIT": "1100000011001111"
  67117. },
  67118. "attributes": {
  67119. "module_not_derived": "00000000000000000000000000000001",
  67120. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67121. },
  67122. "port_directions": {
  67123. "I0": "input",
  67124. "I1": "input",
  67125. "I2": "input",
  67126. "I3": "input",
  67127. "O": "output"
  67128. },
  67129. "connections": {
  67130. "I0": [ "0" ],
  67131. "I1": [ 3086 ],
  67132. "I2": [ 3080 ],
  67133. "I3": [ 3087 ],
  67134. "O": [ 3088 ]
  67135. }
  67136. },
  67137. "cpu_I._zz_32__SB_LUT4_O_10_I3_SB_LUT4_O": {
  67138. "hide_name": 0,
  67139. "type": "SB_LUT4",
  67140. "parameters": {
  67141. "LUT_INIT": "1111001101010001"
  67142. },
  67143. "attributes": {
  67144. "module_not_derived": "00000000000000000000000000000001",
  67145. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67146. },
  67147. "port_directions": {
  67148. "I0": "input",
  67149. "I1": "input",
  67150. "I2": "input",
  67151. "I3": "input",
  67152. "O": "output"
  67153. },
  67154. "connections": {
  67155. "I0": [ 3089 ],
  67156. "I1": [ 3090 ],
  67157. "I2": [ 3091 ],
  67158. "I3": [ 3092 ],
  67159. "O": [ 3087 ]
  67160. }
  67161. },
  67162. "cpu_I._zz_32__SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67163. "hide_name": 0,
  67164. "type": "SB_LUT4",
  67165. "parameters": {
  67166. "LUT_INIT": "0011010100111111"
  67167. },
  67168. "attributes": {
  67169. "module_not_derived": "00000000000000000000000000000001",
  67170. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67171. },
  67172. "port_directions": {
  67173. "I0": "input",
  67174. "I1": "input",
  67175. "I2": "input",
  67176. "I3": "input",
  67177. "O": "output"
  67178. },
  67179. "connections": {
  67180. "I0": [ 3093 ],
  67181. "I1": [ 3094 ],
  67182. "I2": [ 3095 ],
  67183. "I3": [ 3096 ],
  67184. "O": [ 3091 ]
  67185. }
  67186. },
  67187. "cpu_I._zz_32__SB_LUT4_O_11": {
  67188. "hide_name": 0,
  67189. "type": "SB_LUT4",
  67190. "parameters": {
  67191. "LUT_INIT": "1100000011001111"
  67192. },
  67193. "attributes": {
  67194. "module_not_derived": "00000000000000000000000000000001",
  67195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67196. },
  67197. "port_directions": {
  67198. "I0": "input",
  67199. "I1": "input",
  67200. "I2": "input",
  67201. "I3": "input",
  67202. "O": "output"
  67203. },
  67204. "connections": {
  67205. "I0": [ "0" ],
  67206. "I1": [ 3097 ],
  67207. "I2": [ 3080 ],
  67208. "I3": [ 3098 ],
  67209. "O": [ 3099 ]
  67210. }
  67211. },
  67212. "cpu_I._zz_32__SB_LUT4_O_11_I3_SB_LUT4_O": {
  67213. "hide_name": 0,
  67214. "type": "SB_LUT4",
  67215. "parameters": {
  67216. "LUT_INIT": "1111001101010001"
  67217. },
  67218. "attributes": {
  67219. "module_not_derived": "00000000000000000000000000000001",
  67220. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67221. },
  67222. "port_directions": {
  67223. "I0": "input",
  67224. "I1": "input",
  67225. "I2": "input",
  67226. "I3": "input",
  67227. "O": "output"
  67228. },
  67229. "connections": {
  67230. "I0": [ 3100 ],
  67231. "I1": [ 3090 ],
  67232. "I2": [ 3101 ],
  67233. "I3": [ 3092 ],
  67234. "O": [ 3098 ]
  67235. }
  67236. },
  67237. "cpu_I._zz_32__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67238. "hide_name": 0,
  67239. "type": "SB_LUT4",
  67240. "parameters": {
  67241. "LUT_INIT": "0101001101011111"
  67242. },
  67243. "attributes": {
  67244. "module_not_derived": "00000000000000000000000000000001",
  67245. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67246. },
  67247. "port_directions": {
  67248. "I0": "input",
  67249. "I1": "input",
  67250. "I2": "input",
  67251. "I3": "input",
  67252. "O": "output"
  67253. },
  67254. "connections": {
  67255. "I0": [ 3093 ],
  67256. "I1": [ 3094 ],
  67257. "I2": [ 3095 ],
  67258. "I3": [ 3096 ],
  67259. "O": [ 3101 ]
  67260. }
  67261. },
  67262. "cpu_I._zz_32__SB_LUT4_O_12": {
  67263. "hide_name": 0,
  67264. "type": "SB_LUT4",
  67265. "parameters": {
  67266. "LUT_INIT": "1100000011001111"
  67267. },
  67268. "attributes": {
  67269. "module_not_derived": "00000000000000000000000000000001",
  67270. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67271. },
  67272. "port_directions": {
  67273. "I0": "input",
  67274. "I1": "input",
  67275. "I2": "input",
  67276. "I3": "input",
  67277. "O": "output"
  67278. },
  67279. "connections": {
  67280. "I0": [ "0" ],
  67281. "I1": [ 3102 ],
  67282. "I2": [ 3080 ],
  67283. "I3": [ 3103 ],
  67284. "O": [ 3104 ]
  67285. }
  67286. },
  67287. "cpu_I._zz_32__SB_LUT4_O_12_I3_SB_LUT4_O": {
  67288. "hide_name": 0,
  67289. "type": "SB_LUT4",
  67290. "parameters": {
  67291. "LUT_INIT": "1111001101010001"
  67292. },
  67293. "attributes": {
  67294. "module_not_derived": "00000000000000000000000000000001",
  67295. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67296. },
  67297. "port_directions": {
  67298. "I0": "input",
  67299. "I1": "input",
  67300. "I2": "input",
  67301. "I3": "input",
  67302. "O": "output"
  67303. },
  67304. "connections": {
  67305. "I0": [ 3105 ],
  67306. "I1": [ 3090 ],
  67307. "I2": [ 3106 ],
  67308. "I3": [ 3092 ],
  67309. "O": [ 3103 ]
  67310. }
  67311. },
  67312. "cpu_I._zz_32__SB_LUT4_O_12_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67313. "hide_name": 0,
  67314. "type": "SB_LUT4",
  67315. "parameters": {
  67316. "LUT_INIT": "0101001101011111"
  67317. },
  67318. "attributes": {
  67319. "module_not_derived": "00000000000000000000000000000001",
  67320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67321. },
  67322. "port_directions": {
  67323. "I0": "input",
  67324. "I1": "input",
  67325. "I2": "input",
  67326. "I3": "input",
  67327. "O": "output"
  67328. },
  67329. "connections": {
  67330. "I0": [ 3107 ],
  67331. "I1": [ 3108 ],
  67332. "I2": [ 3095 ],
  67333. "I3": [ 3096 ],
  67334. "O": [ 3106 ]
  67335. }
  67336. },
  67337. "cpu_I._zz_32__SB_LUT4_O_13": {
  67338. "hide_name": 0,
  67339. "type": "SB_LUT4",
  67340. "parameters": {
  67341. "LUT_INIT": "1100000011001111"
  67342. },
  67343. "attributes": {
  67344. "module_not_derived": "00000000000000000000000000000001",
  67345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67346. },
  67347. "port_directions": {
  67348. "I0": "input",
  67349. "I1": "input",
  67350. "I2": "input",
  67351. "I3": "input",
  67352. "O": "output"
  67353. },
  67354. "connections": {
  67355. "I0": [ "0" ],
  67356. "I1": [ 3109 ],
  67357. "I2": [ 3080 ],
  67358. "I3": [ 3110 ],
  67359. "O": [ 3111 ]
  67360. }
  67361. },
  67362. "cpu_I._zz_32__SB_LUT4_O_13_I3_SB_LUT4_O": {
  67363. "hide_name": 0,
  67364. "type": "SB_LUT4",
  67365. "parameters": {
  67366. "LUT_INIT": "1111001101010001"
  67367. },
  67368. "attributes": {
  67369. "module_not_derived": "00000000000000000000000000000001",
  67370. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67371. },
  67372. "port_directions": {
  67373. "I0": "input",
  67374. "I1": "input",
  67375. "I2": "input",
  67376. "I3": "input",
  67377. "O": "output"
  67378. },
  67379. "connections": {
  67380. "I0": [ 3112 ],
  67381. "I1": [ 3090 ],
  67382. "I2": [ 3113 ],
  67383. "I3": [ 3092 ],
  67384. "O": [ 3110 ]
  67385. }
  67386. },
  67387. "cpu_I._zz_32__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67388. "hide_name": 0,
  67389. "type": "SB_LUT4",
  67390. "parameters": {
  67391. "LUT_INIT": "0101001101011111"
  67392. },
  67393. "attributes": {
  67394. "module_not_derived": "00000000000000000000000000000001",
  67395. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67396. },
  67397. "port_directions": {
  67398. "I0": "input",
  67399. "I1": "input",
  67400. "I2": "input",
  67401. "I3": "input",
  67402. "O": "output"
  67403. },
  67404. "connections": {
  67405. "I0": [ 3114 ],
  67406. "I1": [ 3115 ],
  67407. "I2": [ 3095 ],
  67408. "I3": [ 3096 ],
  67409. "O": [ 3113 ]
  67410. }
  67411. },
  67412. "cpu_I._zz_32__SB_LUT4_O_14": {
  67413. "hide_name": 0,
  67414. "type": "SB_LUT4",
  67415. "parameters": {
  67416. "LUT_INIT": "1100000011001111"
  67417. },
  67418. "attributes": {
  67419. "module_not_derived": "00000000000000000000000000000001",
  67420. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67421. },
  67422. "port_directions": {
  67423. "I0": "input",
  67424. "I1": "input",
  67425. "I2": "input",
  67426. "I3": "input",
  67427. "O": "output"
  67428. },
  67429. "connections": {
  67430. "I0": [ "0" ],
  67431. "I1": [ 3116 ],
  67432. "I2": [ 3080 ],
  67433. "I3": [ 3117 ],
  67434. "O": [ 3118 ]
  67435. }
  67436. },
  67437. "cpu_I._zz_32__SB_LUT4_O_14_I3_SB_LUT4_O": {
  67438. "hide_name": 0,
  67439. "type": "SB_LUT4",
  67440. "parameters": {
  67441. "LUT_INIT": "1111001101010001"
  67442. },
  67443. "attributes": {
  67444. "module_not_derived": "00000000000000000000000000000001",
  67445. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67446. },
  67447. "port_directions": {
  67448. "I0": "input",
  67449. "I1": "input",
  67450. "I2": "input",
  67451. "I3": "input",
  67452. "O": "output"
  67453. },
  67454. "connections": {
  67455. "I0": [ 3119 ],
  67456. "I1": [ 3090 ],
  67457. "I2": [ 3120 ],
  67458. "I3": [ 3092 ],
  67459. "O": [ 3117 ]
  67460. }
  67461. },
  67462. "cpu_I._zz_32__SB_LUT4_O_14_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67463. "hide_name": 0,
  67464. "type": "SB_LUT4",
  67465. "parameters": {
  67466. "LUT_INIT": "0101001101011111"
  67467. },
  67468. "attributes": {
  67469. "module_not_derived": "00000000000000000000000000000001",
  67470. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67471. },
  67472. "port_directions": {
  67473. "I0": "input",
  67474. "I1": "input",
  67475. "I2": "input",
  67476. "I3": "input",
  67477. "O": "output"
  67478. },
  67479. "connections": {
  67480. "I0": [ 3121 ],
  67481. "I1": [ 3122 ],
  67482. "I2": [ 3095 ],
  67483. "I3": [ 3096 ],
  67484. "O": [ 3120 ]
  67485. }
  67486. },
  67487. "cpu_I._zz_32__SB_LUT4_O_15": {
  67488. "hide_name": 0,
  67489. "type": "SB_LUT4",
  67490. "parameters": {
  67491. "LUT_INIT": "1100000011001111"
  67492. },
  67493. "attributes": {
  67494. "module_not_derived": "00000000000000000000000000000001",
  67495. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67496. },
  67497. "port_directions": {
  67498. "I0": "input",
  67499. "I1": "input",
  67500. "I2": "input",
  67501. "I3": "input",
  67502. "O": "output"
  67503. },
  67504. "connections": {
  67505. "I0": [ "0" ],
  67506. "I1": [ 3123 ],
  67507. "I2": [ 3080 ],
  67508. "I3": [ 3124 ],
  67509. "O": [ 3125 ]
  67510. }
  67511. },
  67512. "cpu_I._zz_32__SB_LUT4_O_15_I3_SB_LUT4_O": {
  67513. "hide_name": 0,
  67514. "type": "SB_LUT4",
  67515. "parameters": {
  67516. "LUT_INIT": "1111001101010001"
  67517. },
  67518. "attributes": {
  67519. "module_not_derived": "00000000000000000000000000000001",
  67520. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67521. },
  67522. "port_directions": {
  67523. "I0": "input",
  67524. "I1": "input",
  67525. "I2": "input",
  67526. "I3": "input",
  67527. "O": "output"
  67528. },
  67529. "connections": {
  67530. "I0": [ 3126 ],
  67531. "I1": [ 3090 ],
  67532. "I2": [ 3127 ],
  67533. "I3": [ 3092 ],
  67534. "O": [ 3124 ]
  67535. }
  67536. },
  67537. "cpu_I._zz_32__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67538. "hide_name": 0,
  67539. "type": "SB_LUT4",
  67540. "parameters": {
  67541. "LUT_INIT": "0101001101011111"
  67542. },
  67543. "attributes": {
  67544. "module_not_derived": "00000000000000000000000000000001",
  67545. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67546. },
  67547. "port_directions": {
  67548. "I0": "input",
  67549. "I1": "input",
  67550. "I2": "input",
  67551. "I3": "input",
  67552. "O": "output"
  67553. },
  67554. "connections": {
  67555. "I0": [ 3128 ],
  67556. "I1": [ 3129 ],
  67557. "I2": [ 3095 ],
  67558. "I3": [ 3096 ],
  67559. "O": [ 3127 ]
  67560. }
  67561. },
  67562. "cpu_I._zz_32__SB_LUT4_O_16": {
  67563. "hide_name": 0,
  67564. "type": "SB_LUT4",
  67565. "parameters": {
  67566. "LUT_INIT": "1100000011001111"
  67567. },
  67568. "attributes": {
  67569. "module_not_derived": "00000000000000000000000000000001",
  67570. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67571. },
  67572. "port_directions": {
  67573. "I0": "input",
  67574. "I1": "input",
  67575. "I2": "input",
  67576. "I3": "input",
  67577. "O": "output"
  67578. },
  67579. "connections": {
  67580. "I0": [ "0" ],
  67581. "I1": [ 3130 ],
  67582. "I2": [ 3080 ],
  67583. "I3": [ 3131 ],
  67584. "O": [ 3132 ]
  67585. }
  67586. },
  67587. "cpu_I._zz_32__SB_LUT4_O_16_I3_SB_LUT4_O": {
  67588. "hide_name": 0,
  67589. "type": "SB_LUT4",
  67590. "parameters": {
  67591. "LUT_INIT": "1111001101010001"
  67592. },
  67593. "attributes": {
  67594. "module_not_derived": "00000000000000000000000000000001",
  67595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67596. },
  67597. "port_directions": {
  67598. "I0": "input",
  67599. "I1": "input",
  67600. "I2": "input",
  67601. "I3": "input",
  67602. "O": "output"
  67603. },
  67604. "connections": {
  67605. "I0": [ 3133 ],
  67606. "I1": [ 3090 ],
  67607. "I2": [ 3134 ],
  67608. "I3": [ 3092 ],
  67609. "O": [ 3131 ]
  67610. }
  67611. },
  67612. "cpu_I._zz_32__SB_LUT4_O_16_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67613. "hide_name": 0,
  67614. "type": "SB_LUT4",
  67615. "parameters": {
  67616. "LUT_INIT": "0101001101011111"
  67617. },
  67618. "attributes": {
  67619. "module_not_derived": "00000000000000000000000000000001",
  67620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67621. },
  67622. "port_directions": {
  67623. "I0": "input",
  67624. "I1": "input",
  67625. "I2": "input",
  67626. "I3": "input",
  67627. "O": "output"
  67628. },
  67629. "connections": {
  67630. "I0": [ 3135 ],
  67631. "I1": [ 3136 ],
  67632. "I2": [ 3095 ],
  67633. "I3": [ 3096 ],
  67634. "O": [ 3134 ]
  67635. }
  67636. },
  67637. "cpu_I._zz_32__SB_LUT4_O_17": {
  67638. "hide_name": 0,
  67639. "type": "SB_LUT4",
  67640. "parameters": {
  67641. "LUT_INIT": "1100000011001111"
  67642. },
  67643. "attributes": {
  67644. "module_not_derived": "00000000000000000000000000000001",
  67645. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67646. },
  67647. "port_directions": {
  67648. "I0": "input",
  67649. "I1": "input",
  67650. "I2": "input",
  67651. "I3": "input",
  67652. "O": "output"
  67653. },
  67654. "connections": {
  67655. "I0": [ "0" ],
  67656. "I1": [ 3137 ],
  67657. "I2": [ 3080 ],
  67658. "I3": [ 3138 ],
  67659. "O": [ 3139 ]
  67660. }
  67661. },
  67662. "cpu_I._zz_32__SB_LUT4_O_17_I3_SB_LUT4_O": {
  67663. "hide_name": 0,
  67664. "type": "SB_LUT4",
  67665. "parameters": {
  67666. "LUT_INIT": "1111001101010001"
  67667. },
  67668. "attributes": {
  67669. "module_not_derived": "00000000000000000000000000000001",
  67670. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67671. },
  67672. "port_directions": {
  67673. "I0": "input",
  67674. "I1": "input",
  67675. "I2": "input",
  67676. "I3": "input",
  67677. "O": "output"
  67678. },
  67679. "connections": {
  67680. "I0": [ 3140 ],
  67681. "I1": [ 3090 ],
  67682. "I2": [ 3141 ],
  67683. "I3": [ 3092 ],
  67684. "O": [ 3138 ]
  67685. }
  67686. },
  67687. "cpu_I._zz_32__SB_LUT4_O_17_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67688. "hide_name": 0,
  67689. "type": "SB_LUT4",
  67690. "parameters": {
  67691. "LUT_INIT": "0101001101011111"
  67692. },
  67693. "attributes": {
  67694. "module_not_derived": "00000000000000000000000000000001",
  67695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67696. },
  67697. "port_directions": {
  67698. "I0": "input",
  67699. "I1": "input",
  67700. "I2": "input",
  67701. "I3": "input",
  67702. "O": "output"
  67703. },
  67704. "connections": {
  67705. "I0": [ 3142 ],
  67706. "I1": [ 3143 ],
  67707. "I2": [ 3095 ],
  67708. "I3": [ 3096 ],
  67709. "O": [ 3141 ]
  67710. }
  67711. },
  67712. "cpu_I._zz_32__SB_LUT4_O_18": {
  67713. "hide_name": 0,
  67714. "type": "SB_LUT4",
  67715. "parameters": {
  67716. "LUT_INIT": "1100000011001111"
  67717. },
  67718. "attributes": {
  67719. "module_not_derived": "00000000000000000000000000000001",
  67720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67721. },
  67722. "port_directions": {
  67723. "I0": "input",
  67724. "I1": "input",
  67725. "I2": "input",
  67726. "I3": "input",
  67727. "O": "output"
  67728. },
  67729. "connections": {
  67730. "I0": [ "0" ],
  67731. "I1": [ 3144 ],
  67732. "I2": [ 3080 ],
  67733. "I3": [ 3145 ],
  67734. "O": [ 3146 ]
  67735. }
  67736. },
  67737. "cpu_I._zz_32__SB_LUT4_O_18_I3_SB_LUT4_O": {
  67738. "hide_name": 0,
  67739. "type": "SB_LUT4",
  67740. "parameters": {
  67741. "LUT_INIT": "1111001101010001"
  67742. },
  67743. "attributes": {
  67744. "module_not_derived": "00000000000000000000000000000001",
  67745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67746. },
  67747. "port_directions": {
  67748. "I0": "input",
  67749. "I1": "input",
  67750. "I2": "input",
  67751. "I3": "input",
  67752. "O": "output"
  67753. },
  67754. "connections": {
  67755. "I0": [ 3147 ],
  67756. "I1": [ 3090 ],
  67757. "I2": [ 3148 ],
  67758. "I3": [ 3092 ],
  67759. "O": [ 3145 ]
  67760. }
  67761. },
  67762. "cpu_I._zz_32__SB_LUT4_O_18_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67763. "hide_name": 0,
  67764. "type": "SB_LUT4",
  67765. "parameters": {
  67766. "LUT_INIT": "0101001101011111"
  67767. },
  67768. "attributes": {
  67769. "module_not_derived": "00000000000000000000000000000001",
  67770. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67771. },
  67772. "port_directions": {
  67773. "I0": "input",
  67774. "I1": "input",
  67775. "I2": "input",
  67776. "I3": "input",
  67777. "O": "output"
  67778. },
  67779. "connections": {
  67780. "I0": [ 3149 ],
  67781. "I1": [ 3150 ],
  67782. "I2": [ 3095 ],
  67783. "I3": [ 3096 ],
  67784. "O": [ 3148 ]
  67785. }
  67786. },
  67787. "cpu_I._zz_32__SB_LUT4_O_19": {
  67788. "hide_name": 0,
  67789. "type": "SB_LUT4",
  67790. "parameters": {
  67791. "LUT_INIT": "1100000011001111"
  67792. },
  67793. "attributes": {
  67794. "module_not_derived": "00000000000000000000000000000001",
  67795. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67796. },
  67797. "port_directions": {
  67798. "I0": "input",
  67799. "I1": "input",
  67800. "I2": "input",
  67801. "I3": "input",
  67802. "O": "output"
  67803. },
  67804. "connections": {
  67805. "I0": [ "0" ],
  67806. "I1": [ 3151 ],
  67807. "I2": [ 3080 ],
  67808. "I3": [ 3152 ],
  67809. "O": [ 3153 ]
  67810. }
  67811. },
  67812. "cpu_I._zz_32__SB_LUT4_O_19_I3_SB_LUT4_O": {
  67813. "hide_name": 0,
  67814. "type": "SB_LUT4",
  67815. "parameters": {
  67816. "LUT_INIT": "1111001101010001"
  67817. },
  67818. "attributes": {
  67819. "module_not_derived": "00000000000000000000000000000001",
  67820. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67821. },
  67822. "port_directions": {
  67823. "I0": "input",
  67824. "I1": "input",
  67825. "I2": "input",
  67826. "I3": "input",
  67827. "O": "output"
  67828. },
  67829. "connections": {
  67830. "I0": [ 3154 ],
  67831. "I1": [ 3090 ],
  67832. "I2": [ 3155 ],
  67833. "I3": [ 3092 ],
  67834. "O": [ 3152 ]
  67835. }
  67836. },
  67837. "cpu_I._zz_32__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67838. "hide_name": 0,
  67839. "type": "SB_LUT4",
  67840. "parameters": {
  67841. "LUT_INIT": "0101001101011111"
  67842. },
  67843. "attributes": {
  67844. "module_not_derived": "00000000000000000000000000000001",
  67845. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67846. },
  67847. "port_directions": {
  67848. "I0": "input",
  67849. "I1": "input",
  67850. "I2": "input",
  67851. "I3": "input",
  67852. "O": "output"
  67853. },
  67854. "connections": {
  67855. "I0": [ 3156 ],
  67856. "I1": [ 3157 ],
  67857. "I2": [ 3095 ],
  67858. "I3": [ 3096 ],
  67859. "O": [ 3155 ]
  67860. }
  67861. },
  67862. "cpu_I._zz_32__SB_LUT4_O_1_I3_SB_LUT4_O": {
  67863. "hide_name": 0,
  67864. "type": "SB_LUT4",
  67865. "parameters": {
  67866. "LUT_INIT": "1111001101010001"
  67867. },
  67868. "attributes": {
  67869. "module_not_derived": "00000000000000000000000000000001",
  67870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67871. },
  67872. "port_directions": {
  67873. "I0": "input",
  67874. "I1": "input",
  67875. "I2": "input",
  67876. "I3": "input",
  67877. "O": "output"
  67878. },
  67879. "connections": {
  67880. "I0": [ 3158 ],
  67881. "I1": [ 3090 ],
  67882. "I2": [ 3159 ],
  67883. "I3": [ 3092 ],
  67884. "O": [ 3084 ]
  67885. }
  67886. },
  67887. "cpu_I._zz_32__SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67888. "hide_name": 0,
  67889. "type": "SB_LUT4",
  67890. "parameters": {
  67891. "LUT_INIT": "0011010100111111"
  67892. },
  67893. "attributes": {
  67894. "module_not_derived": "00000000000000000000000000000001",
  67895. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67896. },
  67897. "port_directions": {
  67898. "I0": "input",
  67899. "I1": "input",
  67900. "I2": "input",
  67901. "I3": "input",
  67902. "O": "output"
  67903. },
  67904. "connections": {
  67905. "I0": [ 3160 ],
  67906. "I1": [ 3161 ],
  67907. "I2": [ 3095 ],
  67908. "I3": [ 3096 ],
  67909. "O": [ 3159 ]
  67910. }
  67911. },
  67912. "cpu_I._zz_32__SB_LUT4_O_2": {
  67913. "hide_name": 0,
  67914. "type": "SB_LUT4",
  67915. "parameters": {
  67916. "LUT_INIT": "1100000011001111"
  67917. },
  67918. "attributes": {
  67919. "module_not_derived": "00000000000000000000000000000001",
  67920. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67921. },
  67922. "port_directions": {
  67923. "I0": "input",
  67924. "I1": "input",
  67925. "I2": "input",
  67926. "I3": "input",
  67927. "O": "output"
  67928. },
  67929. "connections": {
  67930. "I0": [ "0" ],
  67931. "I1": [ 3162 ],
  67932. "I2": [ 3080 ],
  67933. "I3": [ 3163 ],
  67934. "O": [ 3164 ]
  67935. }
  67936. },
  67937. "cpu_I._zz_32__SB_LUT4_O_20": {
  67938. "hide_name": 0,
  67939. "type": "SB_LUT4",
  67940. "parameters": {
  67941. "LUT_INIT": "1100000011001111"
  67942. },
  67943. "attributes": {
  67944. "module_not_derived": "00000000000000000000000000000001",
  67945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  67946. },
  67947. "port_directions": {
  67948. "I0": "input",
  67949. "I1": "input",
  67950. "I2": "input",
  67951. "I3": "input",
  67952. "O": "output"
  67953. },
  67954. "connections": {
  67955. "I0": [ "0" ],
  67956. "I1": [ 3165 ],
  67957. "I2": [ 3080 ],
  67958. "I3": [ 3166 ],
  67959. "O": [ 3167 ]
  67960. }
  67961. },
  67962. "cpu_I._zz_32__SB_LUT4_O_20_I3_SB_LUT4_O": {
  67963. "hide_name": 0,
  67964. "type": "SB_LUT4",
  67965. "parameters": {
  67966. "LUT_INIT": "1111001101010001"
  67967. },
  67968. "attributes": {
  67969. "module_not_derived": "00000000000000000000000000000001",
  67970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67971. },
  67972. "port_directions": {
  67973. "I0": "input",
  67974. "I1": "input",
  67975. "I2": "input",
  67976. "I3": "input",
  67977. "O": "output"
  67978. },
  67979. "connections": {
  67980. "I0": [ 3168 ],
  67981. "I1": [ 3090 ],
  67982. "I2": [ 3169 ],
  67983. "I3": [ 3092 ],
  67984. "O": [ 3166 ]
  67985. }
  67986. },
  67987. "cpu_I._zz_32__SB_LUT4_O_20_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  67988. "hide_name": 0,
  67989. "type": "SB_LUT4",
  67990. "parameters": {
  67991. "LUT_INIT": "0101001101011111"
  67992. },
  67993. "attributes": {
  67994. "module_not_derived": "00000000000000000000000000000001",
  67995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  67996. },
  67997. "port_directions": {
  67998. "I0": "input",
  67999. "I1": "input",
  68000. "I2": "input",
  68001. "I3": "input",
  68002. "O": "output"
  68003. },
  68004. "connections": {
  68005. "I0": [ 3160 ],
  68006. "I1": [ 3161 ],
  68007. "I2": [ 3095 ],
  68008. "I3": [ 3096 ],
  68009. "O": [ 3169 ]
  68010. }
  68011. },
  68012. "cpu_I._zz_32__SB_LUT4_O_21": {
  68013. "hide_name": 0,
  68014. "type": "SB_LUT4",
  68015. "parameters": {
  68016. "LUT_INIT": "1100000011001111"
  68017. },
  68018. "attributes": {
  68019. "module_not_derived": "00000000000000000000000000000001",
  68020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68021. },
  68022. "port_directions": {
  68023. "I0": "input",
  68024. "I1": "input",
  68025. "I2": "input",
  68026. "I3": "input",
  68027. "O": "output"
  68028. },
  68029. "connections": {
  68030. "I0": [ "0" ],
  68031. "I1": [ 3170 ],
  68032. "I2": [ 3080 ],
  68033. "I3": [ 3171 ],
  68034. "O": [ 3172 ]
  68035. }
  68036. },
  68037. "cpu_I._zz_32__SB_LUT4_O_21_I3_SB_LUT4_O": {
  68038. "hide_name": 0,
  68039. "type": "SB_LUT4",
  68040. "parameters": {
  68041. "LUT_INIT": "1111001101010001"
  68042. },
  68043. "attributes": {
  68044. "module_not_derived": "00000000000000000000000000000001",
  68045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68046. },
  68047. "port_directions": {
  68048. "I0": "input",
  68049. "I1": "input",
  68050. "I2": "input",
  68051. "I3": "input",
  68052. "O": "output"
  68053. },
  68054. "connections": {
  68055. "I0": [ 3173 ],
  68056. "I1": [ 3090 ],
  68057. "I2": [ 3174 ],
  68058. "I3": [ 3092 ],
  68059. "O": [ 3171 ]
  68060. }
  68061. },
  68062. "cpu_I._zz_32__SB_LUT4_O_21_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68063. "hide_name": 0,
  68064. "type": "SB_LUT4",
  68065. "parameters": {
  68066. "LUT_INIT": "0100011101110111"
  68067. },
  68068. "attributes": {
  68069. "module_not_derived": "00000000000000000000000000000001",
  68070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68071. },
  68072. "port_directions": {
  68073. "I0": "input",
  68074. "I1": "input",
  68075. "I2": "input",
  68076. "I3": "input",
  68077. "O": "output"
  68078. },
  68079. "connections": {
  68080. "I0": [ 3175 ],
  68081. "I1": [ 3095 ],
  68082. "I2": [ 3096 ],
  68083. "I3": [ 3176 ],
  68084. "O": [ 3174 ]
  68085. }
  68086. },
  68087. "cpu_I._zz_32__SB_LUT4_O_22": {
  68088. "hide_name": 0,
  68089. "type": "SB_LUT4",
  68090. "parameters": {
  68091. "LUT_INIT": "1100000011001111"
  68092. },
  68093. "attributes": {
  68094. "module_not_derived": "00000000000000000000000000000001",
  68095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68096. },
  68097. "port_directions": {
  68098. "I0": "input",
  68099. "I1": "input",
  68100. "I2": "input",
  68101. "I3": "input",
  68102. "O": "output"
  68103. },
  68104. "connections": {
  68105. "I0": [ "0" ],
  68106. "I1": [ 3177 ],
  68107. "I2": [ 3080 ],
  68108. "I3": [ 3178 ],
  68109. "O": [ 3179 ]
  68110. }
  68111. },
  68112. "cpu_I._zz_32__SB_LUT4_O_22_I3_SB_LUT4_O": {
  68113. "hide_name": 0,
  68114. "type": "SB_LUT4",
  68115. "parameters": {
  68116. "LUT_INIT": "1111001101010001"
  68117. },
  68118. "attributes": {
  68119. "module_not_derived": "00000000000000000000000000000001",
  68120. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68121. },
  68122. "port_directions": {
  68123. "I0": "input",
  68124. "I1": "input",
  68125. "I2": "input",
  68126. "I3": "input",
  68127. "O": "output"
  68128. },
  68129. "connections": {
  68130. "I0": [ 3180 ],
  68131. "I1": [ 3090 ],
  68132. "I2": [ 3181 ],
  68133. "I3": [ 3092 ],
  68134. "O": [ 3178 ]
  68135. }
  68136. },
  68137. "cpu_I._zz_32__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68138. "hide_name": 0,
  68139. "type": "SB_LUT4",
  68140. "parameters": {
  68141. "LUT_INIT": "0001001111011111"
  68142. },
  68143. "attributes": {
  68144. "module_not_derived": "00000000000000000000000000000001",
  68145. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68146. },
  68147. "port_directions": {
  68148. "I0": "input",
  68149. "I1": "input",
  68150. "I2": "input",
  68151. "I3": "input",
  68152. "O": "output"
  68153. },
  68154. "connections": {
  68155. "I0": [ 3175 ],
  68156. "I1": [ 3095 ],
  68157. "I2": [ 3096 ],
  68158. "I3": [ 3176 ],
  68159. "O": [ 3181 ]
  68160. }
  68161. },
  68162. "cpu_I._zz_32__SB_LUT4_O_23": {
  68163. "hide_name": 0,
  68164. "type": "SB_LUT4",
  68165. "parameters": {
  68166. "LUT_INIT": "1100111111000000"
  68167. },
  68168. "attributes": {
  68169. "module_not_derived": "00000000000000000000000000000001",
  68170. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68171. },
  68172. "port_directions": {
  68173. "I0": "input",
  68174. "I1": "input",
  68175. "I2": "input",
  68176. "I3": "input",
  68177. "O": "output"
  68178. },
  68179. "connections": {
  68180. "I0": [ "0" ],
  68181. "I1": [ 3182 ],
  68182. "I2": [ 3080 ],
  68183. "I3": [ 3183 ],
  68184. "O": [ 3184 ]
  68185. }
  68186. },
  68187. "cpu_I._zz_32__SB_LUT4_O_23_I3_SB_LUT4_O": {
  68188. "hide_name": 0,
  68189. "type": "SB_LUT4",
  68190. "parameters": {
  68191. "LUT_INIT": "0000111010101110"
  68192. },
  68193. "attributes": {
  68194. "module_not_derived": "00000000000000000000000000000001",
  68195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68196. },
  68197. "port_directions": {
  68198. "I0": "input",
  68199. "I1": "input",
  68200. "I2": "input",
  68201. "I3": "input",
  68202. "O": "output"
  68203. },
  68204. "connections": {
  68205. "I0": [ 3185 ],
  68206. "I1": [ 3090 ],
  68207. "I2": [ 3186 ],
  68208. "I3": [ 3092 ],
  68209. "O": [ 3183 ]
  68210. }
  68211. },
  68212. "cpu_I._zz_32__SB_LUT4_O_24": {
  68213. "hide_name": 0,
  68214. "type": "SB_LUT4",
  68215. "parameters": {
  68216. "LUT_INIT": "1100111111000000"
  68217. },
  68218. "attributes": {
  68219. "module_not_derived": "00000000000000000000000000000001",
  68220. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68221. },
  68222. "port_directions": {
  68223. "I0": "input",
  68224. "I1": "input",
  68225. "I2": "input",
  68226. "I3": "input",
  68227. "O": "output"
  68228. },
  68229. "connections": {
  68230. "I0": [ "0" ],
  68231. "I1": [ 3187 ],
  68232. "I2": [ 3080 ],
  68233. "I3": [ 3188 ],
  68234. "O": [ 3189 ]
  68235. }
  68236. },
  68237. "cpu_I._zz_32__SB_LUT4_O_24_I3_SB_LUT4_O": {
  68238. "hide_name": 0,
  68239. "type": "SB_LUT4",
  68240. "parameters": {
  68241. "LUT_INIT": "0000111010101110"
  68242. },
  68243. "attributes": {
  68244. "module_not_derived": "00000000000000000000000000000001",
  68245. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68246. },
  68247. "port_directions": {
  68248. "I0": "input",
  68249. "I1": "input",
  68250. "I2": "input",
  68251. "I3": "input",
  68252. "O": "output"
  68253. },
  68254. "connections": {
  68255. "I0": [ 3190 ],
  68256. "I1": [ 3090 ],
  68257. "I2": [ 3191 ],
  68258. "I3": [ 3092 ],
  68259. "O": [ 3188 ]
  68260. }
  68261. },
  68262. "cpu_I._zz_32__SB_LUT4_O_24_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68263. "hide_name": 0,
  68264. "type": "SB_LUT4",
  68265. "parameters": {
  68266. "LUT_INIT": "0101001101011111"
  68267. },
  68268. "attributes": {
  68269. "module_not_derived": "00000000000000000000000000000001",
  68270. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68271. },
  68272. "port_directions": {
  68273. "I0": "input",
  68274. "I1": "input",
  68275. "I2": "input",
  68276. "I3": "input",
  68277. "O": "output"
  68278. },
  68279. "connections": {
  68280. "I0": [ 3192 ],
  68281. "I1": [ 3193 ],
  68282. "I2": [ 3095 ],
  68283. "I3": [ 3096 ],
  68284. "O": [ 3191 ]
  68285. }
  68286. },
  68287. "cpu_I._zz_32__SB_LUT4_O_25": {
  68288. "hide_name": 0,
  68289. "type": "SB_LUT4",
  68290. "parameters": {
  68291. "LUT_INIT": "1100111111000000"
  68292. },
  68293. "attributes": {
  68294. "module_not_derived": "00000000000000000000000000000001",
  68295. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68296. },
  68297. "port_directions": {
  68298. "I0": "input",
  68299. "I1": "input",
  68300. "I2": "input",
  68301. "I3": "input",
  68302. "O": "output"
  68303. },
  68304. "connections": {
  68305. "I0": [ "0" ],
  68306. "I1": [ 3194 ],
  68307. "I2": [ 3080 ],
  68308. "I3": [ 3195 ],
  68309. "O": [ 3196 ]
  68310. }
  68311. },
  68312. "cpu_I._zz_32__SB_LUT4_O_25_I3_SB_LUT4_O": {
  68313. "hide_name": 0,
  68314. "type": "SB_LUT4",
  68315. "parameters": {
  68316. "LUT_INIT": "0000111010101110"
  68317. },
  68318. "attributes": {
  68319. "module_not_derived": "00000000000000000000000000000001",
  68320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68321. },
  68322. "port_directions": {
  68323. "I0": "input",
  68324. "I1": "input",
  68325. "I2": "input",
  68326. "I3": "input",
  68327. "O": "output"
  68328. },
  68329. "connections": {
  68330. "I0": [ 3197 ],
  68331. "I1": [ 3090 ],
  68332. "I2": [ 3198 ],
  68333. "I3": [ 3092 ],
  68334. "O": [ 3195 ]
  68335. }
  68336. },
  68337. "cpu_I._zz_32__SB_LUT4_O_25_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68338. "hide_name": 0,
  68339. "type": "SB_LUT4",
  68340. "parameters": {
  68341. "LUT_INIT": "0011010100111111"
  68342. },
  68343. "attributes": {
  68344. "module_not_derived": "00000000000000000000000000000001",
  68345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68346. },
  68347. "port_directions": {
  68348. "I0": "input",
  68349. "I1": "input",
  68350. "I2": "input",
  68351. "I3": "input",
  68352. "O": "output"
  68353. },
  68354. "connections": {
  68355. "I0": [ 3199 ],
  68356. "I1": [ 3200 ],
  68357. "I2": [ 3095 ],
  68358. "I3": [ 3096 ],
  68359. "O": [ 3198 ]
  68360. }
  68361. },
  68362. "cpu_I._zz_32__SB_LUT4_O_26": {
  68363. "hide_name": 0,
  68364. "type": "SB_LUT4",
  68365. "parameters": {
  68366. "LUT_INIT": "1100111111000000"
  68367. },
  68368. "attributes": {
  68369. "module_not_derived": "00000000000000000000000000000001",
  68370. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68371. },
  68372. "port_directions": {
  68373. "I0": "input",
  68374. "I1": "input",
  68375. "I2": "input",
  68376. "I3": "input",
  68377. "O": "output"
  68378. },
  68379. "connections": {
  68380. "I0": [ "0" ],
  68381. "I1": [ 3201 ],
  68382. "I2": [ 3080 ],
  68383. "I3": [ 3202 ],
  68384. "O": [ 3203 ]
  68385. }
  68386. },
  68387. "cpu_I._zz_32__SB_LUT4_O_26_I3_SB_LUT4_O": {
  68388. "hide_name": 0,
  68389. "type": "SB_LUT4",
  68390. "parameters": {
  68391. "LUT_INIT": "0000111010101110"
  68392. },
  68393. "attributes": {
  68394. "module_not_derived": "00000000000000000000000000000001",
  68395. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68396. },
  68397. "port_directions": {
  68398. "I0": "input",
  68399. "I1": "input",
  68400. "I2": "input",
  68401. "I3": "input",
  68402. "O": "output"
  68403. },
  68404. "connections": {
  68405. "I0": [ 3204 ],
  68406. "I1": [ 3090 ],
  68407. "I2": [ 3205 ],
  68408. "I3": [ 3092 ],
  68409. "O": [ 3202 ]
  68410. }
  68411. },
  68412. "cpu_I._zz_32__SB_LUT4_O_26_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68413. "hide_name": 0,
  68414. "type": "SB_LUT4",
  68415. "parameters": {
  68416. "LUT_INIT": "0101001101011111"
  68417. },
  68418. "attributes": {
  68419. "module_not_derived": "00000000000000000000000000000001",
  68420. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68421. },
  68422. "port_directions": {
  68423. "I0": "input",
  68424. "I1": "input",
  68425. "I2": "input",
  68426. "I3": "input",
  68427. "O": "output"
  68428. },
  68429. "connections": {
  68430. "I0": [ 3199 ],
  68431. "I1": [ 3200 ],
  68432. "I2": [ 3095 ],
  68433. "I3": [ 3096 ],
  68434. "O": [ 3205 ]
  68435. }
  68436. },
  68437. "cpu_I._zz_32__SB_LUT4_O_27": {
  68438. "hide_name": 0,
  68439. "type": "SB_LUT4",
  68440. "parameters": {
  68441. "LUT_INIT": "1100111111000000"
  68442. },
  68443. "attributes": {
  68444. "module_not_derived": "00000000000000000000000000000001",
  68445. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68446. },
  68447. "port_directions": {
  68448. "I0": "input",
  68449. "I1": "input",
  68450. "I2": "input",
  68451. "I3": "input",
  68452. "O": "output"
  68453. },
  68454. "connections": {
  68455. "I0": [ "0" ],
  68456. "I1": [ 3206 ],
  68457. "I2": [ 3080 ],
  68458. "I3": [ 3207 ],
  68459. "O": [ 3208 ]
  68460. }
  68461. },
  68462. "cpu_I._zz_32__SB_LUT4_O_27_I3_SB_LUT4_O": {
  68463. "hide_name": 0,
  68464. "type": "SB_LUT4",
  68465. "parameters": {
  68466. "LUT_INIT": "0000111010101110"
  68467. },
  68468. "attributes": {
  68469. "module_not_derived": "00000000000000000000000000000001",
  68470. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68471. },
  68472. "port_directions": {
  68473. "I0": "input",
  68474. "I1": "input",
  68475. "I2": "input",
  68476. "I3": "input",
  68477. "O": "output"
  68478. },
  68479. "connections": {
  68480. "I0": [ 3209 ],
  68481. "I1": [ 3090 ],
  68482. "I2": [ 3210 ],
  68483. "I3": [ 3092 ],
  68484. "O": [ 3207 ]
  68485. }
  68486. },
  68487. "cpu_I._zz_32__SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68488. "hide_name": 0,
  68489. "type": "SB_LUT4",
  68490. "parameters": {
  68491. "LUT_INIT": "0101001101011111"
  68492. },
  68493. "attributes": {
  68494. "module_not_derived": "00000000000000000000000000000001",
  68495. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68496. },
  68497. "port_directions": {
  68498. "I0": "input",
  68499. "I1": "input",
  68500. "I2": "input",
  68501. "I3": "input",
  68502. "O": "output"
  68503. },
  68504. "connections": {
  68505. "I0": [ 3211 ],
  68506. "I1": [ 3212 ],
  68507. "I2": [ 3095 ],
  68508. "I3": [ 3096 ],
  68509. "O": [ 3210 ]
  68510. }
  68511. },
  68512. "cpu_I._zz_32__SB_LUT4_O_28": {
  68513. "hide_name": 0,
  68514. "type": "SB_LUT4",
  68515. "parameters": {
  68516. "LUT_INIT": "1100111111000000"
  68517. },
  68518. "attributes": {
  68519. "module_not_derived": "00000000000000000000000000000001",
  68520. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68521. },
  68522. "port_directions": {
  68523. "I0": "input",
  68524. "I1": "input",
  68525. "I2": "input",
  68526. "I3": "input",
  68527. "O": "output"
  68528. },
  68529. "connections": {
  68530. "I0": [ "0" ],
  68531. "I1": [ 3213 ],
  68532. "I2": [ 3080 ],
  68533. "I3": [ 3214 ],
  68534. "O": [ 3215 ]
  68535. }
  68536. },
  68537. "cpu_I._zz_32__SB_LUT4_O_28_I3_SB_LUT4_O": {
  68538. "hide_name": 0,
  68539. "type": "SB_LUT4",
  68540. "parameters": {
  68541. "LUT_INIT": "0000111010101110"
  68542. },
  68543. "attributes": {
  68544. "module_not_derived": "00000000000000000000000000000001",
  68545. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68546. },
  68547. "port_directions": {
  68548. "I0": "input",
  68549. "I1": "input",
  68550. "I2": "input",
  68551. "I3": "input",
  68552. "O": "output"
  68553. },
  68554. "connections": {
  68555. "I0": [ 3216 ],
  68556. "I1": [ 3090 ],
  68557. "I2": [ 3217 ],
  68558. "I3": [ 3092 ],
  68559. "O": [ 3214 ]
  68560. }
  68561. },
  68562. "cpu_I._zz_32__SB_LUT4_O_28_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68563. "hide_name": 0,
  68564. "type": "SB_LUT4",
  68565. "parameters": {
  68566. "LUT_INIT": "0101001101011111"
  68567. },
  68568. "attributes": {
  68569. "module_not_derived": "00000000000000000000000000000001",
  68570. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68571. },
  68572. "port_directions": {
  68573. "I0": "input",
  68574. "I1": "input",
  68575. "I2": "input",
  68576. "I3": "input",
  68577. "O": "output"
  68578. },
  68579. "connections": {
  68580. "I0": [ 3218 ],
  68581. "I1": [ 3219 ],
  68582. "I2": [ 3095 ],
  68583. "I3": [ 3096 ],
  68584. "O": [ 3217 ]
  68585. }
  68586. },
  68587. "cpu_I._zz_32__SB_LUT4_O_29": {
  68588. "hide_name": 0,
  68589. "type": "SB_LUT4",
  68590. "parameters": {
  68591. "LUT_INIT": "1100111111000000"
  68592. },
  68593. "attributes": {
  68594. "module_not_derived": "00000000000000000000000000000001",
  68595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68596. },
  68597. "port_directions": {
  68598. "I0": "input",
  68599. "I1": "input",
  68600. "I2": "input",
  68601. "I3": "input",
  68602. "O": "output"
  68603. },
  68604. "connections": {
  68605. "I0": [ "0" ],
  68606. "I1": [ 3220 ],
  68607. "I2": [ 3080 ],
  68608. "I3": [ 3221 ],
  68609. "O": [ 3222 ]
  68610. }
  68611. },
  68612. "cpu_I._zz_32__SB_LUT4_O_29_I3_SB_LUT4_O": {
  68613. "hide_name": 0,
  68614. "type": "SB_LUT4",
  68615. "parameters": {
  68616. "LUT_INIT": "0000111010101110"
  68617. },
  68618. "attributes": {
  68619. "module_not_derived": "00000000000000000000000000000001",
  68620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68621. },
  68622. "port_directions": {
  68623. "I0": "input",
  68624. "I1": "input",
  68625. "I2": "input",
  68626. "I3": "input",
  68627. "O": "output"
  68628. },
  68629. "connections": {
  68630. "I0": [ 3223 ],
  68631. "I1": [ 3090 ],
  68632. "I2": [ 3224 ],
  68633. "I3": [ 3092 ],
  68634. "O": [ 3221 ]
  68635. }
  68636. },
  68637. "cpu_I._zz_32__SB_LUT4_O_29_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68638. "hide_name": 0,
  68639. "type": "SB_LUT4",
  68640. "parameters": {
  68641. "LUT_INIT": "0101001101011111"
  68642. },
  68643. "attributes": {
  68644. "module_not_derived": "00000000000000000000000000000001",
  68645. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68646. },
  68647. "port_directions": {
  68648. "I0": "input",
  68649. "I1": "input",
  68650. "I2": "input",
  68651. "I3": "input",
  68652. "O": "output"
  68653. },
  68654. "connections": {
  68655. "I0": [ 3225 ],
  68656. "I1": [ 3226 ],
  68657. "I2": [ 3095 ],
  68658. "I3": [ 3096 ],
  68659. "O": [ 3224 ]
  68660. }
  68661. },
  68662. "cpu_I._zz_32__SB_LUT4_O_2_I3_SB_LUT4_O": {
  68663. "hide_name": 0,
  68664. "type": "SB_LUT4",
  68665. "parameters": {
  68666. "LUT_INIT": "1111001101010001"
  68667. },
  68668. "attributes": {
  68669. "module_not_derived": "00000000000000000000000000000001",
  68670. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68671. },
  68672. "port_directions": {
  68673. "I0": "input",
  68674. "I1": "input",
  68675. "I2": "input",
  68676. "I3": "input",
  68677. "O": "output"
  68678. },
  68679. "connections": {
  68680. "I0": [ 3227 ],
  68681. "I1": [ 3090 ],
  68682. "I2": [ 3228 ],
  68683. "I3": [ 3092 ],
  68684. "O": [ 3163 ]
  68685. }
  68686. },
  68687. "cpu_I._zz_32__SB_LUT4_O_2_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68688. "hide_name": 0,
  68689. "type": "SB_LUT4",
  68690. "parameters": {
  68691. "LUT_INIT": "0011010100111111"
  68692. },
  68693. "attributes": {
  68694. "module_not_derived": "00000000000000000000000000000001",
  68695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68696. },
  68697. "port_directions": {
  68698. "I0": "input",
  68699. "I1": "input",
  68700. "I2": "input",
  68701. "I3": "input",
  68702. "O": "output"
  68703. },
  68704. "connections": {
  68705. "I0": [ 3156 ],
  68706. "I1": [ 3157 ],
  68707. "I2": [ 3095 ],
  68708. "I3": [ 3096 ],
  68709. "O": [ 3228 ]
  68710. }
  68711. },
  68712. "cpu_I._zz_32__SB_LUT4_O_3": {
  68713. "hide_name": 0,
  68714. "type": "SB_LUT4",
  68715. "parameters": {
  68716. "LUT_INIT": "1100000011001111"
  68717. },
  68718. "attributes": {
  68719. "module_not_derived": "00000000000000000000000000000001",
  68720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68721. },
  68722. "port_directions": {
  68723. "I0": "input",
  68724. "I1": "input",
  68725. "I2": "input",
  68726. "I3": "input",
  68727. "O": "output"
  68728. },
  68729. "connections": {
  68730. "I0": [ "0" ],
  68731. "I1": [ 3229 ],
  68732. "I2": [ 3080 ],
  68733. "I3": [ 3230 ],
  68734. "O": [ 3231 ]
  68735. }
  68736. },
  68737. "cpu_I._zz_32__SB_LUT4_O_30": {
  68738. "hide_name": 0,
  68739. "type": "SB_LUT4",
  68740. "parameters": {
  68741. "LUT_INIT": "1100111111000000"
  68742. },
  68743. "attributes": {
  68744. "module_not_derived": "00000000000000000000000000000001",
  68745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68746. },
  68747. "port_directions": {
  68748. "I0": "input",
  68749. "I1": "input",
  68750. "I2": "input",
  68751. "I3": "input",
  68752. "O": "output"
  68753. },
  68754. "connections": {
  68755. "I0": [ "0" ],
  68756. "I1": [ 3232 ],
  68757. "I2": [ 3080 ],
  68758. "I3": [ 3233 ],
  68759. "O": [ 3234 ]
  68760. }
  68761. },
  68762. "cpu_I._zz_32__SB_LUT4_O_30_I3_SB_LUT4_O": {
  68763. "hide_name": 0,
  68764. "type": "SB_LUT4",
  68765. "parameters": {
  68766. "LUT_INIT": "0000111010101110"
  68767. },
  68768. "attributes": {
  68769. "module_not_derived": "00000000000000000000000000000001",
  68770. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68771. },
  68772. "port_directions": {
  68773. "I0": "input",
  68774. "I1": "input",
  68775. "I2": "input",
  68776. "I3": "input",
  68777. "O": "output"
  68778. },
  68779. "connections": {
  68780. "I0": [ 3235 ],
  68781. "I1": [ 3090 ],
  68782. "I2": [ 3236 ],
  68783. "I3": [ 3092 ],
  68784. "O": [ 3233 ]
  68785. }
  68786. },
  68787. "cpu_I._zz_32__SB_LUT4_O_30_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68788. "hide_name": 0,
  68789. "type": "SB_LUT4",
  68790. "parameters": {
  68791. "LUT_INIT": "0011010100111111"
  68792. },
  68793. "attributes": {
  68794. "module_not_derived": "00000000000000000000000000000001",
  68795. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68796. },
  68797. "port_directions": {
  68798. "I0": "input",
  68799. "I1": "input",
  68800. "I2": "input",
  68801. "I3": "input",
  68802. "O": "output"
  68803. },
  68804. "connections": {
  68805. "I0": [ 3192 ],
  68806. "I1": [ 3193 ],
  68807. "I2": [ 3095 ],
  68808. "I3": [ 3096 ],
  68809. "O": [ 3236 ]
  68810. }
  68811. },
  68812. "cpu_I._zz_32__SB_LUT4_O_31": {
  68813. "hide_name": 0,
  68814. "type": "SB_LUT4",
  68815. "parameters": {
  68816. "LUT_INIT": "1100111111000000"
  68817. },
  68818. "attributes": {
  68819. "module_not_derived": "00000000000000000000000000000001",
  68820. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68821. },
  68822. "port_directions": {
  68823. "I0": "input",
  68824. "I1": "input",
  68825. "I2": "input",
  68826. "I3": "input",
  68827. "O": "output"
  68828. },
  68829. "connections": {
  68830. "I0": [ "0" ],
  68831. "I1": [ 3237 ],
  68832. "I2": [ 3080 ],
  68833. "I3": [ 3238 ],
  68834. "O": [ 3239 ]
  68835. }
  68836. },
  68837. "cpu_I._zz_32__SB_LUT4_O_31_I3_SB_LUT4_O": {
  68838. "hide_name": 0,
  68839. "type": "SB_LUT4",
  68840. "parameters": {
  68841. "LUT_INIT": "0000111010101110"
  68842. },
  68843. "attributes": {
  68844. "module_not_derived": "00000000000000000000000000000001",
  68845. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68846. },
  68847. "port_directions": {
  68848. "I0": "input",
  68849. "I1": "input",
  68850. "I2": "input",
  68851. "I3": "input",
  68852. "O": "output"
  68853. },
  68854. "connections": {
  68855. "I0": [ 3240 ],
  68856. "I1": [ 3090 ],
  68857. "I2": [ 3241 ],
  68858. "I3": [ 3092 ],
  68859. "O": [ 3238 ]
  68860. }
  68861. },
  68862. "cpu_I._zz_32__SB_LUT4_O_31_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68863. "hide_name": 0,
  68864. "type": "SB_LUT4",
  68865. "parameters": {
  68866. "LUT_INIT": "0011010100111111"
  68867. },
  68868. "attributes": {
  68869. "module_not_derived": "00000000000000000000000000000001",
  68870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68871. },
  68872. "port_directions": {
  68873. "I0": "input",
  68874. "I1": "input",
  68875. "I2": "input",
  68876. "I3": "input",
  68877. "O": "output"
  68878. },
  68879. "connections": {
  68880. "I0": [ 3225 ],
  68881. "I1": [ 3226 ],
  68882. "I2": [ 3095 ],
  68883. "I3": [ 3096 ],
  68884. "O": [ 3241 ]
  68885. }
  68886. },
  68887. "cpu_I._zz_32__SB_LUT4_O_3_I3_SB_LUT4_O": {
  68888. "hide_name": 0,
  68889. "type": "SB_LUT4",
  68890. "parameters": {
  68891. "LUT_INIT": "1111001101010001"
  68892. },
  68893. "attributes": {
  68894. "module_not_derived": "00000000000000000000000000000001",
  68895. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68896. },
  68897. "port_directions": {
  68898. "I0": "input",
  68899. "I1": "input",
  68900. "I2": "input",
  68901. "I3": "input",
  68902. "O": "output"
  68903. },
  68904. "connections": {
  68905. "I0": [ 3242 ],
  68906. "I1": [ 3090 ],
  68907. "I2": [ 3243 ],
  68908. "I3": [ 3092 ],
  68909. "O": [ 3230 ]
  68910. }
  68911. },
  68912. "cpu_I._zz_32__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68913. "hide_name": 0,
  68914. "type": "SB_LUT4",
  68915. "parameters": {
  68916. "LUT_INIT": "0011010100111111"
  68917. },
  68918. "attributes": {
  68919. "module_not_derived": "00000000000000000000000000000001",
  68920. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68921. },
  68922. "port_directions": {
  68923. "I0": "input",
  68924. "I1": "input",
  68925. "I2": "input",
  68926. "I3": "input",
  68927. "O": "output"
  68928. },
  68929. "connections": {
  68930. "I0": [ 3149 ],
  68931. "I1": [ 3150 ],
  68932. "I2": [ 3095 ],
  68933. "I3": [ 3096 ],
  68934. "O": [ 3243 ]
  68935. }
  68936. },
  68937. "cpu_I._zz_32__SB_LUT4_O_4": {
  68938. "hide_name": 0,
  68939. "type": "SB_LUT4",
  68940. "parameters": {
  68941. "LUT_INIT": "1100000011001111"
  68942. },
  68943. "attributes": {
  68944. "module_not_derived": "00000000000000000000000000000001",
  68945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  68946. },
  68947. "port_directions": {
  68948. "I0": "input",
  68949. "I1": "input",
  68950. "I2": "input",
  68951. "I3": "input",
  68952. "O": "output"
  68953. },
  68954. "connections": {
  68955. "I0": [ "0" ],
  68956. "I1": [ 3244 ],
  68957. "I2": [ 3080 ],
  68958. "I3": [ 3245 ],
  68959. "O": [ 3246 ]
  68960. }
  68961. },
  68962. "cpu_I._zz_32__SB_LUT4_O_4_I3_SB_LUT4_O": {
  68963. "hide_name": 0,
  68964. "type": "SB_LUT4",
  68965. "parameters": {
  68966. "LUT_INIT": "1111001101010001"
  68967. },
  68968. "attributes": {
  68969. "module_not_derived": "00000000000000000000000000000001",
  68970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68971. },
  68972. "port_directions": {
  68973. "I0": "input",
  68974. "I1": "input",
  68975. "I2": "input",
  68976. "I3": "input",
  68977. "O": "output"
  68978. },
  68979. "connections": {
  68980. "I0": [ 3247 ],
  68981. "I1": [ 3090 ],
  68982. "I2": [ 3248 ],
  68983. "I3": [ 3092 ],
  68984. "O": [ 3245 ]
  68985. }
  68986. },
  68987. "cpu_I._zz_32__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  68988. "hide_name": 0,
  68989. "type": "SB_LUT4",
  68990. "parameters": {
  68991. "LUT_INIT": "0011010100111111"
  68992. },
  68993. "attributes": {
  68994. "module_not_derived": "00000000000000000000000000000001",
  68995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  68996. },
  68997. "port_directions": {
  68998. "I0": "input",
  68999. "I1": "input",
  69000. "I2": "input",
  69001. "I3": "input",
  69002. "O": "output"
  69003. },
  69004. "connections": {
  69005. "I0": [ 3142 ],
  69006. "I1": [ 3143 ],
  69007. "I2": [ 3095 ],
  69008. "I3": [ 3096 ],
  69009. "O": [ 3248 ]
  69010. }
  69011. },
  69012. "cpu_I._zz_32__SB_LUT4_O_5": {
  69013. "hide_name": 0,
  69014. "type": "SB_LUT4",
  69015. "parameters": {
  69016. "LUT_INIT": "1100000011001111"
  69017. },
  69018. "attributes": {
  69019. "module_not_derived": "00000000000000000000000000000001",
  69020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69021. },
  69022. "port_directions": {
  69023. "I0": "input",
  69024. "I1": "input",
  69025. "I2": "input",
  69026. "I3": "input",
  69027. "O": "output"
  69028. },
  69029. "connections": {
  69030. "I0": [ "0" ],
  69031. "I1": [ 3249 ],
  69032. "I2": [ 3080 ],
  69033. "I3": [ 3250 ],
  69034. "O": [ 3251 ]
  69035. }
  69036. },
  69037. "cpu_I._zz_32__SB_LUT4_O_5_I3_SB_LUT4_O": {
  69038. "hide_name": 0,
  69039. "type": "SB_LUT4",
  69040. "parameters": {
  69041. "LUT_INIT": "1111001101010001"
  69042. },
  69043. "attributes": {
  69044. "module_not_derived": "00000000000000000000000000000001",
  69045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69046. },
  69047. "port_directions": {
  69048. "I0": "input",
  69049. "I1": "input",
  69050. "I2": "input",
  69051. "I3": "input",
  69052. "O": "output"
  69053. },
  69054. "connections": {
  69055. "I0": [ 3252 ],
  69056. "I1": [ 3090 ],
  69057. "I2": [ 3253 ],
  69058. "I3": [ 3092 ],
  69059. "O": [ 3250 ]
  69060. }
  69061. },
  69062. "cpu_I._zz_32__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  69063. "hide_name": 0,
  69064. "type": "SB_LUT4",
  69065. "parameters": {
  69066. "LUT_INIT": "0011010100111111"
  69067. },
  69068. "attributes": {
  69069. "module_not_derived": "00000000000000000000000000000001",
  69070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69071. },
  69072. "port_directions": {
  69073. "I0": "input",
  69074. "I1": "input",
  69075. "I2": "input",
  69076. "I3": "input",
  69077. "O": "output"
  69078. },
  69079. "connections": {
  69080. "I0": [ 3135 ],
  69081. "I1": [ 3136 ],
  69082. "I2": [ 3095 ],
  69083. "I3": [ 3096 ],
  69084. "O": [ 3253 ]
  69085. }
  69086. },
  69087. "cpu_I._zz_32__SB_LUT4_O_6": {
  69088. "hide_name": 0,
  69089. "type": "SB_LUT4",
  69090. "parameters": {
  69091. "LUT_INIT": "1100000011001111"
  69092. },
  69093. "attributes": {
  69094. "module_not_derived": "00000000000000000000000000000001",
  69095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69096. },
  69097. "port_directions": {
  69098. "I0": "input",
  69099. "I1": "input",
  69100. "I2": "input",
  69101. "I3": "input",
  69102. "O": "output"
  69103. },
  69104. "connections": {
  69105. "I0": [ "0" ],
  69106. "I1": [ 3254 ],
  69107. "I2": [ 3080 ],
  69108. "I3": [ 3255 ],
  69109. "O": [ 3256 ]
  69110. }
  69111. },
  69112. "cpu_I._zz_32__SB_LUT4_O_6_I3_SB_LUT4_O": {
  69113. "hide_name": 0,
  69114. "type": "SB_LUT4",
  69115. "parameters": {
  69116. "LUT_INIT": "1111001101010001"
  69117. },
  69118. "attributes": {
  69119. "module_not_derived": "00000000000000000000000000000001",
  69120. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69121. },
  69122. "port_directions": {
  69123. "I0": "input",
  69124. "I1": "input",
  69125. "I2": "input",
  69126. "I3": "input",
  69127. "O": "output"
  69128. },
  69129. "connections": {
  69130. "I0": [ 3257 ],
  69131. "I1": [ 3090 ],
  69132. "I2": [ 3258 ],
  69133. "I3": [ 3092 ],
  69134. "O": [ 3255 ]
  69135. }
  69136. },
  69137. "cpu_I._zz_32__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  69138. "hide_name": 0,
  69139. "type": "SB_LUT4",
  69140. "parameters": {
  69141. "LUT_INIT": "0011010100111111"
  69142. },
  69143. "attributes": {
  69144. "module_not_derived": "00000000000000000000000000000001",
  69145. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69146. },
  69147. "port_directions": {
  69148. "I0": "input",
  69149. "I1": "input",
  69150. "I2": "input",
  69151. "I3": "input",
  69152. "O": "output"
  69153. },
  69154. "connections": {
  69155. "I0": [ 3128 ],
  69156. "I1": [ 3129 ],
  69157. "I2": [ 3095 ],
  69158. "I3": [ 3096 ],
  69159. "O": [ 3258 ]
  69160. }
  69161. },
  69162. "cpu_I._zz_32__SB_LUT4_O_7": {
  69163. "hide_name": 0,
  69164. "type": "SB_LUT4",
  69165. "parameters": {
  69166. "LUT_INIT": "1100000011001111"
  69167. },
  69168. "attributes": {
  69169. "module_not_derived": "00000000000000000000000000000001",
  69170. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69171. },
  69172. "port_directions": {
  69173. "I0": "input",
  69174. "I1": "input",
  69175. "I2": "input",
  69176. "I3": "input",
  69177. "O": "output"
  69178. },
  69179. "connections": {
  69180. "I0": [ "0" ],
  69181. "I1": [ 3259 ],
  69182. "I2": [ 3080 ],
  69183. "I3": [ 3260 ],
  69184. "O": [ 3261 ]
  69185. }
  69186. },
  69187. "cpu_I._zz_32__SB_LUT4_O_7_I3_SB_LUT4_O": {
  69188. "hide_name": 0,
  69189. "type": "SB_LUT4",
  69190. "parameters": {
  69191. "LUT_INIT": "1111001101010001"
  69192. },
  69193. "attributes": {
  69194. "module_not_derived": "00000000000000000000000000000001",
  69195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69196. },
  69197. "port_directions": {
  69198. "I0": "input",
  69199. "I1": "input",
  69200. "I2": "input",
  69201. "I3": "input",
  69202. "O": "output"
  69203. },
  69204. "connections": {
  69205. "I0": [ 3262 ],
  69206. "I1": [ 3090 ],
  69207. "I2": [ 3263 ],
  69208. "I3": [ 3092 ],
  69209. "O": [ 3260 ]
  69210. }
  69211. },
  69212. "cpu_I._zz_32__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  69213. "hide_name": 0,
  69214. "type": "SB_LUT4",
  69215. "parameters": {
  69216. "LUT_INIT": "0011010100111111"
  69217. },
  69218. "attributes": {
  69219. "module_not_derived": "00000000000000000000000000000001",
  69220. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69221. },
  69222. "port_directions": {
  69223. "I0": "input",
  69224. "I1": "input",
  69225. "I2": "input",
  69226. "I3": "input",
  69227. "O": "output"
  69228. },
  69229. "connections": {
  69230. "I0": [ 3121 ],
  69231. "I1": [ 3122 ],
  69232. "I2": [ 3095 ],
  69233. "I3": [ 3096 ],
  69234. "O": [ 3263 ]
  69235. }
  69236. },
  69237. "cpu_I._zz_32__SB_LUT4_O_8": {
  69238. "hide_name": 0,
  69239. "type": "SB_LUT4",
  69240. "parameters": {
  69241. "LUT_INIT": "1100000011001111"
  69242. },
  69243. "attributes": {
  69244. "module_not_derived": "00000000000000000000000000000001",
  69245. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69246. },
  69247. "port_directions": {
  69248. "I0": "input",
  69249. "I1": "input",
  69250. "I2": "input",
  69251. "I3": "input",
  69252. "O": "output"
  69253. },
  69254. "connections": {
  69255. "I0": [ "0" ],
  69256. "I1": [ 3264 ],
  69257. "I2": [ 3080 ],
  69258. "I3": [ 3265 ],
  69259. "O": [ 3266 ]
  69260. }
  69261. },
  69262. "cpu_I._zz_32__SB_LUT4_O_8_I3_SB_LUT4_O": {
  69263. "hide_name": 0,
  69264. "type": "SB_LUT4",
  69265. "parameters": {
  69266. "LUT_INIT": "1111001101010001"
  69267. },
  69268. "attributes": {
  69269. "module_not_derived": "00000000000000000000000000000001",
  69270. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69271. },
  69272. "port_directions": {
  69273. "I0": "input",
  69274. "I1": "input",
  69275. "I2": "input",
  69276. "I3": "input",
  69277. "O": "output"
  69278. },
  69279. "connections": {
  69280. "I0": [ 3267 ],
  69281. "I1": [ 3090 ],
  69282. "I2": [ 3268 ],
  69283. "I3": [ 3092 ],
  69284. "O": [ 3265 ]
  69285. }
  69286. },
  69287. "cpu_I._zz_32__SB_LUT4_O_8_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  69288. "hide_name": 0,
  69289. "type": "SB_LUT4",
  69290. "parameters": {
  69291. "LUT_INIT": "0011010100111111"
  69292. },
  69293. "attributes": {
  69294. "module_not_derived": "00000000000000000000000000000001",
  69295. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69296. },
  69297. "port_directions": {
  69298. "I0": "input",
  69299. "I1": "input",
  69300. "I2": "input",
  69301. "I3": "input",
  69302. "O": "output"
  69303. },
  69304. "connections": {
  69305. "I0": [ 3114 ],
  69306. "I1": [ 3115 ],
  69307. "I2": [ 3095 ],
  69308. "I3": [ 3096 ],
  69309. "O": [ 3268 ]
  69310. }
  69311. },
  69312. "cpu_I._zz_32__SB_LUT4_O_9": {
  69313. "hide_name": 0,
  69314. "type": "SB_LUT4",
  69315. "parameters": {
  69316. "LUT_INIT": "1100000011001111"
  69317. },
  69318. "attributes": {
  69319. "module_not_derived": "00000000000000000000000000000001",
  69320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69321. },
  69322. "port_directions": {
  69323. "I0": "input",
  69324. "I1": "input",
  69325. "I2": "input",
  69326. "I3": "input",
  69327. "O": "output"
  69328. },
  69329. "connections": {
  69330. "I0": [ "0" ],
  69331. "I1": [ 3269 ],
  69332. "I2": [ 3080 ],
  69333. "I3": [ 3270 ],
  69334. "O": [ 3271 ]
  69335. }
  69336. },
  69337. "cpu_I._zz_32__SB_LUT4_O_9_I3_SB_LUT4_O": {
  69338. "hide_name": 0,
  69339. "type": "SB_LUT4",
  69340. "parameters": {
  69341. "LUT_INIT": "1111001101010001"
  69342. },
  69343. "attributes": {
  69344. "module_not_derived": "00000000000000000000000000000001",
  69345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69346. },
  69347. "port_directions": {
  69348. "I0": "input",
  69349. "I1": "input",
  69350. "I2": "input",
  69351. "I3": "input",
  69352. "O": "output"
  69353. },
  69354. "connections": {
  69355. "I0": [ 3272 ],
  69356. "I1": [ 3090 ],
  69357. "I2": [ 3273 ],
  69358. "I3": [ 3092 ],
  69359. "O": [ 3270 ]
  69360. }
  69361. },
  69362. "cpu_I._zz_32__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  69363. "hide_name": 0,
  69364. "type": "SB_LUT4",
  69365. "parameters": {
  69366. "LUT_INIT": "0011010100111111"
  69367. },
  69368. "attributes": {
  69369. "module_not_derived": "00000000000000000000000000000001",
  69370. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69371. },
  69372. "port_directions": {
  69373. "I0": "input",
  69374. "I1": "input",
  69375. "I2": "input",
  69376. "I3": "input",
  69377. "O": "output"
  69378. },
  69379. "connections": {
  69380. "I0": [ 3107 ],
  69381. "I1": [ 3108 ],
  69382. "I2": [ 3095 ],
  69383. "I3": [ 3096 ],
  69384. "O": [ 3273 ]
  69385. }
  69386. },
  69387. "cpu_I._zz_32__SB_LUT4_O_I3_SB_LUT4_O": {
  69388. "hide_name": 0,
  69389. "type": "SB_LUT4",
  69390. "parameters": {
  69391. "LUT_INIT": "1111001101010001"
  69392. },
  69393. "attributes": {
  69394. "module_not_derived": "00000000000000000000000000000001",
  69395. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69396. },
  69397. "port_directions": {
  69398. "I0": "input",
  69399. "I1": "input",
  69400. "I2": "input",
  69401. "I3": "input",
  69402. "O": "output"
  69403. },
  69404. "connections": {
  69405. "I0": [ 3274 ],
  69406. "I1": [ 3090 ],
  69407. "I2": [ 3275 ],
  69408. "I3": [ 3092 ],
  69409. "O": [ 3081 ]
  69410. }
  69411. },
  69412. "cpu_I._zz_32__SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  69413. "hide_name": 0,
  69414. "type": "SB_LUT4",
  69415. "parameters": {
  69416. "LUT_INIT": "0011010100111111"
  69417. },
  69418. "attributes": {
  69419. "module_not_derived": "00000000000000000000000000000001",
  69420. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69421. },
  69422. "port_directions": {
  69423. "I0": "input",
  69424. "I1": "input",
  69425. "I2": "input",
  69426. "I3": "input",
  69427. "O": "output"
  69428. },
  69429. "connections": {
  69430. "I0": [ 3211 ],
  69431. "I1": [ 3212 ],
  69432. "I2": [ 3095 ],
  69433. "I3": [ 3096 ],
  69434. "O": [ 3275 ]
  69435. }
  69436. },
  69437. "cpu_I._zz_32__SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  69438. "hide_name": 0,
  69439. "type": "SB_LUT4",
  69440. "parameters": {
  69441. "LUT_INIT": "1111110000000000"
  69442. },
  69443. "attributes": {
  69444. "module_not_derived": "00000000000000000000000000000001",
  69445. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69446. },
  69447. "port_directions": {
  69448. "I0": "input",
  69449. "I1": "input",
  69450. "I2": "input",
  69451. "I3": "input",
  69452. "O": "output"
  69453. },
  69454. "connections": {
  69455. "I0": [ "0" ],
  69456. "I1": [ 3095 ],
  69457. "I2": [ 3096 ],
  69458. "I3": [ 3090 ],
  69459. "O": [ 3092 ]
  69460. }
  69461. },
  69462. "cpu_I._zz_32__SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_1": {
  69463. "hide_name": 0,
  69464. "type": "SB_LUT4",
  69465. "parameters": {
  69466. "LUT_INIT": "0011010100111111"
  69467. },
  69468. "attributes": {
  69469. "module_not_derived": "00000000000000000000000000000001",
  69470. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69471. },
  69472. "port_directions": {
  69473. "I0": "input",
  69474. "I1": "input",
  69475. "I2": "input",
  69476. "I3": "input",
  69477. "O": "output"
  69478. },
  69479. "connections": {
  69480. "I0": [ 3218 ],
  69481. "I1": [ 3219 ],
  69482. "I2": [ 3095 ],
  69483. "I3": [ 3096 ],
  69484. "O": [ 3186 ]
  69485. }
  69486. },
  69487. "cpu_I._zz_372__SB_LUT4_I1": {
  69488. "hide_name": 0,
  69489. "type": "SB_LUT4",
  69490. "parameters": {
  69491. "LUT_INIT": "0000001100000000"
  69492. },
  69493. "attributes": {
  69494. "module_not_derived": "00000000000000000000000000000001",
  69495. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69496. },
  69497. "port_directions": {
  69498. "I0": "input",
  69499. "I1": "input",
  69500. "I2": "input",
  69501. "I3": "input",
  69502. "O": "output"
  69503. },
  69504. "connections": {
  69505. "I0": [ "0" ],
  69506. "I1": [ 3276 ],
  69507. "I2": [ 2343 ],
  69508. "I3": [ 2342 ],
  69509. "O": [ 3277 ]
  69510. }
  69511. },
  69512. "cpu_I._zz_372__SB_LUT4_I1_O_SB_LUT4_O": {
  69513. "hide_name": 0,
  69514. "type": "SB_LUT4",
  69515. "parameters": {
  69516. "LUT_INIT": "0000000000000011"
  69517. },
  69518. "attributes": {
  69519. "module_not_derived": "00000000000000000000000000000001",
  69520. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69521. },
  69522. "port_directions": {
  69523. "I0": "input",
  69524. "I1": "input",
  69525. "I2": "input",
  69526. "I3": "input",
  69527. "O": "output"
  69528. },
  69529. "connections": {
  69530. "I0": [ "0" ],
  69531. "I1": [ 2336 ],
  69532. "I2": [ 2331 ],
  69533. "I3": [ 3278 ],
  69534. "O": [ 3279 ]
  69535. }
  69536. },
  69537. "cpu_I._zz_372__SB_LUT4_I1_O_SB_LUT4_O_1": {
  69538. "hide_name": 0,
  69539. "type": "SB_LUT4",
  69540. "parameters": {
  69541. "LUT_INIT": "0010101000111111"
  69542. },
  69543. "attributes": {
  69544. "module_not_derived": "00000000000000000000000000000001",
  69545. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69546. },
  69547. "port_directions": {
  69548. "I0": "input",
  69549. "I1": "input",
  69550. "I2": "input",
  69551. "I3": "input",
  69552. "O": "output"
  69553. },
  69554. "connections": {
  69555. "I0": [ 3280 ],
  69556. "I1": [ 3281 ],
  69557. "I2": [ 3282 ],
  69558. "I3": [ 3283 ],
  69559. "O": [ 3284 ]
  69560. }
  69561. },
  69562. "cpu_I._zz_372__SB_LUT4_O": {
  69563. "hide_name": 0,
  69564. "type": "SB_LUT4",
  69565. "parameters": {
  69566. "LUT_INIT": "0000000000110000"
  69567. },
  69568. "attributes": {
  69569. "module_not_derived": "00000000000000000000000000000001",
  69570. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69571. },
  69572. "port_directions": {
  69573. "I0": "input",
  69574. "I1": "input",
  69575. "I2": "input",
  69576. "I3": "input",
  69577. "O": "output"
  69578. },
  69579. "connections": {
  69580. "I0": [ "0" ],
  69581. "I1": [ 1536 ],
  69582. "I2": [ 1537 ],
  69583. "I3": [ 2328 ],
  69584. "O": [ 3276 ]
  69585. }
  69586. },
  69587. "cpu_I._zz_389__SB_LUT4_O": {
  69588. "hide_name": 0,
  69589. "type": "SB_LUT4",
  69590. "parameters": {
  69591. "LUT_INIT": "0000111100000000"
  69592. },
  69593. "attributes": {
  69594. "module_not_derived": "00000000000000000000000000000001",
  69595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  69596. },
  69597. "port_directions": {
  69598. "I0": "input",
  69599. "I1": "input",
  69600. "I2": "input",
  69601. "I3": "input",
  69602. "O": "output"
  69603. },
  69604. "connections": {
  69605. "I0": [ "0" ],
  69606. "I1": [ "0" ],
  69607. "I2": [ 1540 ],
  69608. "I3": [ 3285 ],
  69609. "O": [ 3286 ]
  69610. }
  69611. },
  69612. "cpu_I._zz_389__SB_LUT4_O_I3_SB_LUT4_O": {
  69613. "hide_name": 0,
  69614. "type": "SB_LUT4",
  69615. "parameters": {
  69616. "LUT_INIT": "0000001100000000"
  69617. },
  69618. "attributes": {
  69619. "module_not_derived": "00000000000000000000000000000001",
  69620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69621. },
  69622. "port_directions": {
  69623. "I0": "input",
  69624. "I1": "input",
  69625. "I2": "input",
  69626. "I3": "input",
  69627. "O": "output"
  69628. },
  69629. "connections": {
  69630. "I0": [ "0" ],
  69631. "I1": [ 1537 ],
  69632. "I2": [ 1362 ],
  69633. "I3": [ 2336 ],
  69634. "O": [ 3285 ]
  69635. }
  69636. },
  69637. "cpu_I._zz_391__SB_LUT4_O": {
  69638. "hide_name": 0,
  69639. "type": "SB_LUT4",
  69640. "parameters": {
  69641. "LUT_INIT": "0000110000000000"
  69642. },
  69643. "attributes": {
  69644. "module_not_derived": "00000000000000000000000000000001",
  69645. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69646. },
  69647. "port_directions": {
  69648. "I0": "input",
  69649. "I1": "input",
  69650. "I2": "input",
  69651. "I3": "input",
  69652. "O": "output"
  69653. },
  69654. "connections": {
  69655. "I0": [ "0" ],
  69656. "I1": [ 1540 ],
  69657. "I2": [ 1551 ],
  69658. "I3": [ 3285 ],
  69659. "O": [ 3287 ]
  69660. }
  69661. },
  69662. "cpu_I._zz_405__SB_DFFE_Q": {
  69663. "hide_name": 0,
  69664. "type": "SB_DFFE",
  69665. "parameters": {
  69666. },
  69667. "attributes": {
  69668. "module_not_derived": "00000000000000000000000000000001",
  69669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  69670. },
  69671. "port_directions": {
  69672. "C": "input",
  69673. "D": "input",
  69674. "E": "input",
  69675. "Q": "output"
  69676. },
  69677. "connections": {
  69678. "C": [ 42 ],
  69679. "D": [ 1268 ],
  69680. "E": [ 1472 ],
  69681. "Q": [ 1362 ]
  69682. }
  69683. },
  69684. "cpu_I._zz_407__SB_LUT4_O": {
  69685. "hide_name": 0,
  69686. "type": "SB_LUT4",
  69687. "parameters": {
  69688. "LUT_INIT": "0000000011110000"
  69689. },
  69690. "attributes": {
  69691. "module_not_derived": "00000000000000000000000000000001",
  69692. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  69693. },
  69694. "port_directions": {
  69695. "I0": "input",
  69696. "I1": "input",
  69697. "I2": "input",
  69698. "I3": "input",
  69699. "O": "output"
  69700. },
  69701. "connections": {
  69702. "I0": [ "0" ],
  69703. "I1": [ "0" ],
  69704. "I2": [ 1537 ],
  69705. "I3": [ 1362 ],
  69706. "O": [ 3288 ]
  69707. }
  69708. },
  69709. "cpu_I._zz_408__SB_LUT4_I3": {
  69710. "hide_name": 0,
  69711. "type": "SB_LUT4",
  69712. "parameters": {
  69713. "LUT_INIT": "0011000000000000"
  69714. },
  69715. "attributes": {
  69716. "module_not_derived": "00000000000000000000000000000001",
  69717. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69718. },
  69719. "port_directions": {
  69720. "I0": "input",
  69721. "I1": "input",
  69722. "I2": "input",
  69723. "I3": "input",
  69724. "O": "output"
  69725. },
  69726. "connections": {
  69727. "I0": [ "0" ],
  69728. "I1": [ 1537 ],
  69729. "I2": [ 1362 ],
  69730. "I3": [ 3289 ],
  69731. "O": [ 3290 ]
  69732. }
  69733. },
  69734. "cpu_I._zz_408__SB_LUT4_O": {
  69735. "hide_name": 0,
  69736. "type": "SB_LUT4",
  69737. "parameters": {
  69738. "LUT_INIT": "0000000011110000"
  69739. },
  69740. "attributes": {
  69741. "module_not_derived": "00000000000000000000000000000001",
  69742. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  69743. },
  69744. "port_directions": {
  69745. "I0": "input",
  69746. "I1": "input",
  69747. "I2": "input",
  69748. "I3": "input",
  69749. "O": "output"
  69750. },
  69751. "connections": {
  69752. "I0": [ "0" ],
  69753. "I1": [ "0" ],
  69754. "I2": [ 1536 ],
  69755. "I3": [ 2328 ],
  69756. "O": [ 3289 ]
  69757. }
  69758. },
  69759. "cpu_I._zz_415__SB_LUT4_O": {
  69760. "hide_name": 0,
  69761. "type": "SB_LUT4",
  69762. "parameters": {
  69763. "LUT_INIT": "0000000000110000"
  69764. },
  69765. "attributes": {
  69766. "module_not_derived": "00000000000000000000000000000001",
  69767. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69768. },
  69769. "port_directions": {
  69770. "I0": "input",
  69771. "I1": "input",
  69772. "I2": "input",
  69773. "I3": "input",
  69774. "O": "output"
  69775. },
  69776. "connections": {
  69777. "I0": [ "0" ],
  69778. "I1": [ 2334 ],
  69779. "I2": [ 3290 ],
  69780. "I3": [ 2335 ],
  69781. "O": [ 3291 ]
  69782. }
  69783. },
  69784. "cpu_I._zz_416__SB_LUT4_O": {
  69785. "hide_name": 0,
  69786. "type": "SB_LUT4",
  69787. "parameters": {
  69788. "LUT_INIT": "0101010101000000"
  69789. },
  69790. "attributes": {
  69791. "module_not_derived": "00000000000000000000000000000001",
  69792. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69793. },
  69794. "port_directions": {
  69795. "I0": "input",
  69796. "I1": "input",
  69797. "I2": "input",
  69798. "I3": "input",
  69799. "O": "output"
  69800. },
  69801. "connections": {
  69802. "I0": [ 1537 ],
  69803. "I1": [ 3292 ],
  69804. "I2": [ 2343 ],
  69805. "I3": [ 3293 ],
  69806. "O": [ 3294 ]
  69807. }
  69808. },
  69809. "cpu_I._zz_416__SB_LUT4_O_I1_SB_LUT4_I3": {
  69810. "hide_name": 0,
  69811. "type": "SB_LUT4",
  69812. "parameters": {
  69813. "LUT_INIT": "0000000011110000"
  69814. },
  69815. "attributes": {
  69816. "module_not_derived": "00000000000000000000000000000001",
  69817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  69818. },
  69819. "port_directions": {
  69820. "I0": "input",
  69821. "I1": "input",
  69822. "I2": "input",
  69823. "I3": "input",
  69824. "O": "output"
  69825. },
  69826. "connections": {
  69827. "I0": [ "0" ],
  69828. "I1": [ "0" ],
  69829. "I2": [ 1363 ],
  69830. "I3": [ 3292 ],
  69831. "O": [ 2335 ]
  69832. }
  69833. },
  69834. "cpu_I._zz_416__SB_LUT4_O_I1_SB_LUT4_I3_O_SB_LUT4_O": {
  69835. "hide_name": 0,
  69836. "type": "SB_LUT4",
  69837. "parameters": {
  69838. "LUT_INIT": "1100110000001111"
  69839. },
  69840. "attributes": {
  69841. "module_not_derived": "00000000000000000000000000000001",
  69842. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69843. },
  69844. "port_directions": {
  69845. "I0": "input",
  69846. "I1": "input",
  69847. "I2": "input",
  69848. "I3": "input",
  69849. "O": "output"
  69850. },
  69851. "connections": {
  69852. "I0": [ "0" ],
  69853. "I1": [ 1548 ],
  69854. "I2": [ 1543 ],
  69855. "I3": [ 2329 ],
  69856. "O": [ 2334 ]
  69857. }
  69858. },
  69859. "cpu_I._zz_416__SB_LUT4_O_I1_SB_LUT4_O": {
  69860. "hide_name": 0,
  69861. "type": "SB_LUT4",
  69862. "parameters": {
  69863. "LUT_INIT": "0000000011110000"
  69864. },
  69865. "attributes": {
  69866. "module_not_derived": "00000000000000000000000000000001",
  69867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  69868. },
  69869. "port_directions": {
  69870. "I0": "input",
  69871. "I1": "input",
  69872. "I2": "input",
  69873. "I3": "input",
  69874. "O": "output"
  69875. },
  69876. "connections": {
  69877. "I0": [ "0" ],
  69878. "I1": [ "0" ],
  69879. "I2": [ 1543 ],
  69880. "I3": [ 2329 ],
  69881. "O": [ 3292 ]
  69882. }
  69883. },
  69884. "cpu_I._zz_416__SB_LUT4_O_I3_SB_LUT4_O": {
  69885. "hide_name": 0,
  69886. "type": "SB_LUT4",
  69887. "parameters": {
  69888. "LUT_INIT": "1010101100000000"
  69889. },
  69890. "attributes": {
  69891. "module_not_derived": "00000000000000000000000000000001",
  69892. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69893. },
  69894. "port_directions": {
  69895. "I0": "input",
  69896. "I1": "input",
  69897. "I2": "input",
  69898. "I3": "input",
  69899. "O": "output"
  69900. },
  69901. "connections": {
  69902. "I0": [ 1528 ],
  69903. "I1": [ 1548 ],
  69904. "I2": [ 1536 ],
  69905. "I3": [ 3295 ],
  69906. "O": [ 3293 ]
  69907. }
  69908. },
  69909. "cpu_I._zz_416__SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  69910. "hide_name": 0,
  69911. "type": "SB_LUT4",
  69912. "parameters": {
  69913. "LUT_INIT": "0000000000100000"
  69914. },
  69915. "attributes": {
  69916. "module_not_derived": "00000000000000000000000000000001",
  69917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  69918. },
  69919. "port_directions": {
  69920. "I0": "input",
  69921. "I1": "input",
  69922. "I2": "input",
  69923. "I3": "input",
  69924. "O": "output"
  69925. },
  69926. "connections": {
  69927. "I0": [ 1362 ],
  69928. "I1": [ 1363 ],
  69929. "I2": [ 1543 ],
  69930. "I3": [ 2328 ],
  69931. "O": [ 3295 ]
  69932. }
  69933. },
  69934. "cpu_I._zz_444__SB_DFFE_Q": {
  69935. "hide_name": 0,
  69936. "type": "SB_DFFE",
  69937. "parameters": {
  69938. },
  69939. "attributes": {
  69940. "module_not_derived": "00000000000000000000000000000001",
  69941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  69942. },
  69943. "port_directions": {
  69944. "C": "input",
  69945. "D": "input",
  69946. "E": "input",
  69947. "Q": "output"
  69948. },
  69949. "connections": {
  69950. "C": [ 42 ],
  69951. "D": [ 2853 ],
  69952. "E": [ 2263 ],
  69953. "Q": [ 978 ]
  69954. }
  69955. },
  69956. "cpu_I._zz_50__SB_LUT4_O": {
  69957. "hide_name": 0,
  69958. "type": "SB_LUT4",
  69959. "parameters": {
  69960. "LUT_INIT": "0000110000111111"
  69961. },
  69962. "attributes": {
  69963. "module_not_derived": "00000000000000000000000000000001",
  69964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  69965. },
  69966. "port_directions": {
  69967. "I0": "input",
  69968. "I1": "input",
  69969. "I2": "input",
  69970. "I3": "input",
  69971. "O": "output"
  69972. },
  69973. "connections": {
  69974. "I0": [ "0" ],
  69975. "I1": [ 3296 ],
  69976. "I2": [ 3297 ],
  69977. "I3": [ 3298 ],
  69978. "O": [ 2287 ]
  69979. }
  69980. },
  69981. "cpu_I._zz_50__SB_LUT4_O_1": {
  69982. "hide_name": 0,
  69983. "type": "SB_LUT4",
  69984. "parameters": {
  69985. "LUT_INIT": "1111111111110000"
  69986. },
  69987. "attributes": {
  69988. "module_not_derived": "00000000000000000000000000000001",
  69989. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  69990. },
  69991. "port_directions": {
  69992. "I0": "input",
  69993. "I1": "input",
  69994. "I2": "input",
  69995. "I3": "input",
  69996. "O": "output"
  69997. },
  69998. "connections": {
  69999. "I0": [ "0" ],
  70000. "I1": [ "0" ],
  70001. "I2": [ 3299 ],
  70002. "I3": [ 3300 ],
  70003. "O": [ 2276 ]
  70004. }
  70005. },
  70006. "cpu_I._zz_50__SB_LUT4_O_10": {
  70007. "hide_name": 0,
  70008. "type": "SB_LUT4",
  70009. "parameters": {
  70010. "LUT_INIT": "1111111111110000"
  70011. },
  70012. "attributes": {
  70013. "module_not_derived": "00000000000000000000000000000001",
  70014. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70015. },
  70016. "port_directions": {
  70017. "I0": "input",
  70018. "I1": "input",
  70019. "I2": "input",
  70020. "I3": "input",
  70021. "O": "output"
  70022. },
  70023. "connections": {
  70024. "I0": [ "0" ],
  70025. "I1": [ "0" ],
  70026. "I2": [ 3301 ],
  70027. "I3": [ 3302 ],
  70028. "O": [ 2297 ]
  70029. }
  70030. },
  70031. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O": {
  70032. "hide_name": 0,
  70033. "type": "SB_LUT4",
  70034. "parameters": {
  70035. "LUT_INIT": "1000000011110000"
  70036. },
  70037. "attributes": {
  70038. "module_not_derived": "00000000000000000000000000000001",
  70039. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70040. },
  70041. "port_directions": {
  70042. "I0": "input",
  70043. "I1": "input",
  70044. "I2": "input",
  70045. "I3": "input",
  70046. "O": "output"
  70047. },
  70048. "connections": {
  70049. "I0": [ 3303 ],
  70050. "I1": [ 3304 ],
  70051. "I2": [ 3305 ],
  70052. "I3": [ 3306 ],
  70053. "O": [ 3302 ]
  70054. }
  70055. },
  70056. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_1": {
  70057. "hide_name": 0,
  70058. "type": "SB_LUT4",
  70059. "parameters": {
  70060. "LUT_INIT": "1000110010000000"
  70061. },
  70062. "attributes": {
  70063. "module_not_derived": "00000000000000000000000000000001",
  70064. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70065. },
  70066. "port_directions": {
  70067. "I0": "input",
  70068. "I1": "input",
  70069. "I2": "input",
  70070. "I3": "input",
  70071. "O": "output"
  70072. },
  70073. "connections": {
  70074. "I0": [ 3307 ],
  70075. "I1": [ 3296 ],
  70076. "I2": [ 3308 ],
  70077. "I3": [ 3309 ],
  70078. "O": [ 3301 ]
  70079. }
  70080. },
  70081. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  70082. "hide_name": 0,
  70083. "type": "SB_LUT4",
  70084. "parameters": {
  70085. "LUT_INIT": "0110100110010110"
  70086. },
  70087. "attributes": {
  70088. "module_not_derived": "00000000000000000000000000000001",
  70089. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70090. },
  70091. "port_directions": {
  70092. "I0": "input",
  70093. "I1": "input",
  70094. "I2": "input",
  70095. "I3": "input",
  70096. "O": "output"
  70097. },
  70098. "connections": {
  70099. "I0": [ "0" ],
  70100. "I1": [ 3310 ],
  70101. "I2": [ 3311 ],
  70102. "I3": [ 3312 ],
  70103. "O": [ 3309 ]
  70104. }
  70105. },
  70106. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  70107. "hide_name": 0,
  70108. "type": "SB_CARRY",
  70109. "parameters": {
  70110. },
  70111. "attributes": {
  70112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  70113. },
  70114. "port_directions": {
  70115. "CI": "input",
  70116. "CO": "output",
  70117. "I0": "input",
  70118. "I1": "input"
  70119. },
  70120. "connections": {
  70121. "CI": [ 3313 ],
  70122. "CO": [ 3312 ],
  70123. "I0": [ 3310 ],
  70124. "I1": [ 3314 ]
  70125. }
  70126. },
  70127. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  70128. "hide_name": 0,
  70129. "type": "SB_LUT4",
  70130. "parameters": {
  70131. "LUT_INIT": "0000000011111100"
  70132. },
  70133. "attributes": {
  70134. "module_not_derived": "00000000000000000000000000000001",
  70135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  70136. },
  70137. "port_directions": {
  70138. "I0": "input",
  70139. "I1": "input",
  70140. "I2": "input",
  70141. "I3": "input",
  70142. "O": "output"
  70143. },
  70144. "connections": {
  70145. "I0": [ "0" ],
  70146. "I1": [ 3315 ],
  70147. "I2": [ 3316 ],
  70148. "I3": [ 3296 ],
  70149. "O": [ 3305 ]
  70150. }
  70151. },
  70152. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  70153. "hide_name": 0,
  70154. "type": "SB_DFFR",
  70155. "parameters": {
  70156. },
  70157. "attributes": {
  70158. "module_not_derived": "00000000000000000000000000000001",
  70159. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  70160. },
  70161. "port_directions": {
  70162. "C": "input",
  70163. "D": "input",
  70164. "Q": "output",
  70165. "R": "input"
  70166. },
  70167. "connections": {
  70168. "C": [ 42 ],
  70169. "D": [ 3146 ],
  70170. "Q": [ 3315 ],
  70171. "R": [ 127 ]
  70172. }
  70173. },
  70174. "cpu_I._zz_50__SB_LUT4_O_11": {
  70175. "hide_name": 0,
  70176. "type": "SB_LUT4",
  70177. "parameters": {
  70178. "LUT_INIT": "1111111111110000"
  70179. },
  70180. "attributes": {
  70181. "module_not_derived": "00000000000000000000000000000001",
  70182. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70183. },
  70184. "port_directions": {
  70185. "I0": "input",
  70186. "I1": "input",
  70187. "I2": "input",
  70188. "I3": "input",
  70189. "O": "output"
  70190. },
  70191. "connections": {
  70192. "I0": [ "0" ],
  70193. "I1": [ "0" ],
  70194. "I2": [ 3317 ],
  70195. "I3": [ 3318 ],
  70196. "O": [ 2296 ]
  70197. }
  70198. },
  70199. "cpu_I._zz_50__SB_LUT4_O_11_I2_SB_LUT4_O": {
  70200. "hide_name": 0,
  70201. "type": "SB_LUT4",
  70202. "parameters": {
  70203. "LUT_INIT": "1000000011110000"
  70204. },
  70205. "attributes": {
  70206. "module_not_derived": "00000000000000000000000000000001",
  70207. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70208. },
  70209. "port_directions": {
  70210. "I0": "input",
  70211. "I1": "input",
  70212. "I2": "input",
  70213. "I3": "input",
  70214. "O": "output"
  70215. },
  70216. "connections": {
  70217. "I0": [ 3319 ],
  70218. "I1": [ 3304 ],
  70219. "I2": [ 3320 ],
  70220. "I3": [ 3306 ],
  70221. "O": [ 3318 ]
  70222. }
  70223. },
  70224. "cpu_I._zz_50__SB_LUT4_O_11_I2_SB_LUT4_O_1": {
  70225. "hide_name": 0,
  70226. "type": "SB_LUT4",
  70227. "parameters": {
  70228. "LUT_INIT": "1000110010000000"
  70229. },
  70230. "attributes": {
  70231. "module_not_derived": "00000000000000000000000000000001",
  70232. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70233. },
  70234. "port_directions": {
  70235. "I0": "input",
  70236. "I1": "input",
  70237. "I2": "input",
  70238. "I3": "input",
  70239. "O": "output"
  70240. },
  70241. "connections": {
  70242. "I0": [ 3321 ],
  70243. "I1": [ 3296 ],
  70244. "I2": [ 3308 ],
  70245. "I3": [ 3322 ],
  70246. "O": [ 3317 ]
  70247. }
  70248. },
  70249. "cpu_I._zz_50__SB_LUT4_O_11_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  70250. "hide_name": 0,
  70251. "type": "SB_LUT4",
  70252. "parameters": {
  70253. "LUT_INIT": "0110100110010110"
  70254. },
  70255. "attributes": {
  70256. "module_not_derived": "00000000000000000000000000000001",
  70257. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70258. },
  70259. "port_directions": {
  70260. "I0": "input",
  70261. "I1": "input",
  70262. "I2": "input",
  70263. "I3": "input",
  70264. "O": "output"
  70265. },
  70266. "connections": {
  70267. "I0": [ "0" ],
  70268. "I1": [ 3310 ],
  70269. "I2": [ 3323 ],
  70270. "I3": [ 3324 ],
  70271. "O": [ 3322 ]
  70272. }
  70273. },
  70274. "cpu_I._zz_50__SB_LUT4_O_11_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  70275. "hide_name": 0,
  70276. "type": "SB_CARRY",
  70277. "parameters": {
  70278. },
  70279. "attributes": {
  70280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  70281. },
  70282. "port_directions": {
  70283. "CI": "input",
  70284. "CO": "output",
  70285. "I0": "input",
  70286. "I1": "input"
  70287. },
  70288. "connections": {
  70289. "CI": [ 3312 ],
  70290. "CO": [ 3324 ],
  70291. "I0": [ 3310 ],
  70292. "I1": [ 3311 ]
  70293. }
  70294. },
  70295. "cpu_I._zz_50__SB_LUT4_O_12": {
  70296. "hide_name": 0,
  70297. "type": "SB_LUT4",
  70298. "parameters": {
  70299. "LUT_INIT": "1111111111110000"
  70300. },
  70301. "attributes": {
  70302. "module_not_derived": "00000000000000000000000000000001",
  70303. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70304. },
  70305. "port_directions": {
  70306. "I0": "input",
  70307. "I1": "input",
  70308. "I2": "input",
  70309. "I3": "input",
  70310. "O": "output"
  70311. },
  70312. "connections": {
  70313. "I0": [ "0" ],
  70314. "I1": [ "0" ],
  70315. "I2": [ 3325 ],
  70316. "I3": [ 3326 ],
  70317. "O": [ 2295 ]
  70318. }
  70319. },
  70320. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O": {
  70321. "hide_name": 0,
  70322. "type": "SB_LUT4",
  70323. "parameters": {
  70324. "LUT_INIT": "1000000011110000"
  70325. },
  70326. "attributes": {
  70327. "module_not_derived": "00000000000000000000000000000001",
  70328. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70329. },
  70330. "port_directions": {
  70331. "I0": "input",
  70332. "I1": "input",
  70333. "I2": "input",
  70334. "I3": "input",
  70335. "O": "output"
  70336. },
  70337. "connections": {
  70338. "I0": [ 3327 ],
  70339. "I1": [ 3304 ],
  70340. "I2": [ 3328 ],
  70341. "I3": [ 3306 ],
  70342. "O": [ 3325 ]
  70343. }
  70344. },
  70345. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_1": {
  70346. "hide_name": 0,
  70347. "type": "SB_LUT4",
  70348. "parameters": {
  70349. "LUT_INIT": "1000110010000000"
  70350. },
  70351. "attributes": {
  70352. "module_not_derived": "00000000000000000000000000000001",
  70353. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70354. },
  70355. "port_directions": {
  70356. "I0": "input",
  70357. "I1": "input",
  70358. "I2": "input",
  70359. "I3": "input",
  70360. "O": "output"
  70361. },
  70362. "connections": {
  70363. "I0": [ 3329 ],
  70364. "I1": [ 3296 ],
  70365. "I2": [ 3308 ],
  70366. "I3": [ 3330 ],
  70367. "O": [ 3326 ]
  70368. }
  70369. },
  70370. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  70371. "hide_name": 0,
  70372. "type": "SB_LUT4",
  70373. "parameters": {
  70374. "LUT_INIT": "0110100110010110"
  70375. },
  70376. "attributes": {
  70377. "module_not_derived": "00000000000000000000000000000001",
  70378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70379. },
  70380. "port_directions": {
  70381. "I0": "input",
  70382. "I1": "input",
  70383. "I2": "input",
  70384. "I3": "input",
  70385. "O": "output"
  70386. },
  70387. "connections": {
  70388. "I0": [ "0" ],
  70389. "I1": [ 3310 ],
  70390. "I2": [ 3331 ],
  70391. "I3": [ 3332 ],
  70392. "O": [ 3330 ]
  70393. }
  70394. },
  70395. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  70396. "hide_name": 0,
  70397. "type": "SB_CARRY",
  70398. "parameters": {
  70399. },
  70400. "attributes": {
  70401. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  70402. },
  70403. "port_directions": {
  70404. "CI": "input",
  70405. "CO": "output",
  70406. "I0": "input",
  70407. "I1": "input"
  70408. },
  70409. "connections": {
  70410. "CI": [ 3324 ],
  70411. "CO": [ 3332 ],
  70412. "I0": [ 3310 ],
  70413. "I1": [ 3323 ]
  70414. }
  70415. },
  70416. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  70417. "hide_name": 0,
  70418. "type": "SB_LUT4",
  70419. "parameters": {
  70420. "LUT_INIT": "0000000011111100"
  70421. },
  70422. "attributes": {
  70423. "module_not_derived": "00000000000000000000000000000001",
  70424. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  70425. },
  70426. "port_directions": {
  70427. "I0": "input",
  70428. "I1": "input",
  70429. "I2": "input",
  70430. "I3": "input",
  70431. "O": "output"
  70432. },
  70433. "connections": {
  70434. "I0": [ "0" ],
  70435. "I1": [ 3333 ],
  70436. "I2": [ 3316 ],
  70437. "I3": [ 3296 ],
  70438. "O": [ 3328 ]
  70439. }
  70440. },
  70441. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  70442. "hide_name": 0,
  70443. "type": "SB_DFFR",
  70444. "parameters": {
  70445. },
  70446. "attributes": {
  70447. "module_not_derived": "00000000000000000000000000000001",
  70448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  70449. },
  70450. "port_directions": {
  70451. "C": "input",
  70452. "D": "input",
  70453. "Q": "output",
  70454. "R": "input"
  70455. },
  70456. "connections": {
  70457. "C": [ 42 ],
  70458. "D": [ 3167 ],
  70459. "Q": [ 3333 ],
  70460. "R": [ 127 ]
  70461. }
  70462. },
  70463. "cpu_I._zz_50__SB_LUT4_O_13": {
  70464. "hide_name": 0,
  70465. "type": "SB_LUT4",
  70466. "parameters": {
  70467. "LUT_INIT": "1111111111110000"
  70468. },
  70469. "attributes": {
  70470. "module_not_derived": "00000000000000000000000000000001",
  70471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70472. },
  70473. "port_directions": {
  70474. "I0": "input",
  70475. "I1": "input",
  70476. "I2": "input",
  70477. "I3": "input",
  70478. "O": "output"
  70479. },
  70480. "connections": {
  70481. "I0": [ "0" ],
  70482. "I1": [ "0" ],
  70483. "I2": [ 3334 ],
  70484. "I3": [ 3335 ],
  70485. "O": [ 2292 ]
  70486. }
  70487. },
  70488. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O": {
  70489. "hide_name": 0,
  70490. "type": "SB_LUT4",
  70491. "parameters": {
  70492. "LUT_INIT": "1000000011110000"
  70493. },
  70494. "attributes": {
  70495. "module_not_derived": "00000000000000000000000000000001",
  70496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70497. },
  70498. "port_directions": {
  70499. "I0": "input",
  70500. "I1": "input",
  70501. "I2": "input",
  70502. "I3": "input",
  70503. "O": "output"
  70504. },
  70505. "connections": {
  70506. "I0": [ 3336 ],
  70507. "I1": [ 3304 ],
  70508. "I2": [ 3337 ],
  70509. "I3": [ 3306 ],
  70510. "O": [ 3334 ]
  70511. }
  70512. },
  70513. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_1": {
  70514. "hide_name": 0,
  70515. "type": "SB_LUT4",
  70516. "parameters": {
  70517. "LUT_INIT": "1000110010000000"
  70518. },
  70519. "attributes": {
  70520. "module_not_derived": "00000000000000000000000000000001",
  70521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70522. },
  70523. "port_directions": {
  70524. "I0": "input",
  70525. "I1": "input",
  70526. "I2": "input",
  70527. "I3": "input",
  70528. "O": "output"
  70529. },
  70530. "connections": {
  70531. "I0": [ 3338 ],
  70532. "I1": [ 3296 ],
  70533. "I2": [ 3308 ],
  70534. "I3": [ 3339 ],
  70535. "O": [ 3335 ]
  70536. }
  70537. },
  70538. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  70539. "hide_name": 0,
  70540. "type": "SB_LUT4",
  70541. "parameters": {
  70542. "LUT_INIT": "0110100110010110"
  70543. },
  70544. "attributes": {
  70545. "module_not_derived": "00000000000000000000000000000001",
  70546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70547. },
  70548. "port_directions": {
  70549. "I0": "input",
  70550. "I1": "input",
  70551. "I2": "input",
  70552. "I3": "input",
  70553. "O": "output"
  70554. },
  70555. "connections": {
  70556. "I0": [ "0" ],
  70557. "I1": [ 3310 ],
  70558. "I2": [ 3340 ],
  70559. "I3": [ 3341 ],
  70560. "O": [ 3339 ]
  70561. }
  70562. },
  70563. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  70564. "hide_name": 0,
  70565. "type": "SB_CARRY",
  70566. "parameters": {
  70567. },
  70568. "attributes": {
  70569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  70570. },
  70571. "port_directions": {
  70572. "CI": "input",
  70573. "CO": "output",
  70574. "I0": "input",
  70575. "I1": "input"
  70576. },
  70577. "connections": {
  70578. "CI": [ 3332 ],
  70579. "CO": [ 3341 ],
  70580. "I0": [ 3310 ],
  70581. "I1": [ 3331 ]
  70582. }
  70583. },
  70584. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  70585. "hide_name": 0,
  70586. "type": "SB_LUT4",
  70587. "parameters": {
  70588. "LUT_INIT": "0000000011111100"
  70589. },
  70590. "attributes": {
  70591. "module_not_derived": "00000000000000000000000000000001",
  70592. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  70593. },
  70594. "port_directions": {
  70595. "I0": "input",
  70596. "I1": "input",
  70597. "I2": "input",
  70598. "I3": "input",
  70599. "O": "output"
  70600. },
  70601. "connections": {
  70602. "I0": [ "0" ],
  70603. "I1": [ 3342 ],
  70604. "I2": [ 3316 ],
  70605. "I3": [ 3296 ],
  70606. "O": [ 3337 ]
  70607. }
  70608. },
  70609. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  70610. "hide_name": 0,
  70611. "type": "SB_DFFR",
  70612. "parameters": {
  70613. },
  70614. "attributes": {
  70615. "module_not_derived": "00000000000000000000000000000001",
  70616. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  70617. },
  70618. "port_directions": {
  70619. "C": "input",
  70620. "D": "input",
  70621. "Q": "output",
  70622. "R": "input"
  70623. },
  70624. "connections": {
  70625. "C": [ 42 ],
  70626. "D": [ 3208 ],
  70627. "Q": [ 3342 ],
  70628. "R": [ 127 ]
  70629. }
  70630. },
  70631. "cpu_I._zz_50__SB_LUT4_O_14": {
  70632. "hide_name": 0,
  70633. "type": "SB_LUT4",
  70634. "parameters": {
  70635. "LUT_INIT": "1111111111110000"
  70636. },
  70637. "attributes": {
  70638. "module_not_derived": "00000000000000000000000000000001",
  70639. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70640. },
  70641. "port_directions": {
  70642. "I0": "input",
  70643. "I1": "input",
  70644. "I2": "input",
  70645. "I3": "input",
  70646. "O": "output"
  70647. },
  70648. "connections": {
  70649. "I0": [ "0" ],
  70650. "I1": [ "0" ],
  70651. "I2": [ 3343 ],
  70652. "I3": [ 3344 ],
  70653. "O": [ 2281 ]
  70654. }
  70655. },
  70656. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O": {
  70657. "hide_name": 0,
  70658. "type": "SB_LUT4",
  70659. "parameters": {
  70660. "LUT_INIT": "1000000011110000"
  70661. },
  70662. "attributes": {
  70663. "module_not_derived": "00000000000000000000000000000001",
  70664. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70665. },
  70666. "port_directions": {
  70667. "I0": "input",
  70668. "I1": "input",
  70669. "I2": "input",
  70670. "I3": "input",
  70671. "O": "output"
  70672. },
  70673. "connections": {
  70674. "I0": [ 3345 ],
  70675. "I1": [ 3304 ],
  70676. "I2": [ 3346 ],
  70677. "I3": [ 3306 ],
  70678. "O": [ 3343 ]
  70679. }
  70680. },
  70681. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_1": {
  70682. "hide_name": 0,
  70683. "type": "SB_LUT4",
  70684. "parameters": {
  70685. "LUT_INIT": "1000110010000000"
  70686. },
  70687. "attributes": {
  70688. "module_not_derived": "00000000000000000000000000000001",
  70689. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70690. },
  70691. "port_directions": {
  70692. "I0": "input",
  70693. "I1": "input",
  70694. "I2": "input",
  70695. "I3": "input",
  70696. "O": "output"
  70697. },
  70698. "connections": {
  70699. "I0": [ 3347 ],
  70700. "I1": [ 3296 ],
  70701. "I2": [ 3308 ],
  70702. "I3": [ 3348 ],
  70703. "O": [ 3344 ]
  70704. }
  70705. },
  70706. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  70707. "hide_name": 0,
  70708. "type": "SB_LUT4",
  70709. "parameters": {
  70710. "LUT_INIT": "0110100110010110"
  70711. },
  70712. "attributes": {
  70713. "module_not_derived": "00000000000000000000000000000001",
  70714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70715. },
  70716. "port_directions": {
  70717. "I0": "input",
  70718. "I1": "input",
  70719. "I2": "input",
  70720. "I3": "input",
  70721. "O": "output"
  70722. },
  70723. "connections": {
  70724. "I0": [ "0" ],
  70725. "I1": [ 3310 ],
  70726. "I2": [ 3349 ],
  70727. "I3": [ 3350 ],
  70728. "O": [ 3348 ]
  70729. }
  70730. },
  70731. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  70732. "hide_name": 0,
  70733. "type": "SB_CARRY",
  70734. "parameters": {
  70735. },
  70736. "attributes": {
  70737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  70738. },
  70739. "port_directions": {
  70740. "CI": "input",
  70741. "CO": "output",
  70742. "I0": "input",
  70743. "I1": "input"
  70744. },
  70745. "connections": {
  70746. "CI": [ 3341 ],
  70747. "CO": [ 3350 ],
  70748. "I0": [ 3310 ],
  70749. "I1": [ 3340 ]
  70750. }
  70751. },
  70752. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  70753. "hide_name": 0,
  70754. "type": "SB_LUT4",
  70755. "parameters": {
  70756. "LUT_INIT": "0000000011111100"
  70757. },
  70758. "attributes": {
  70759. "module_not_derived": "00000000000000000000000000000001",
  70760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  70761. },
  70762. "port_directions": {
  70763. "I0": "input",
  70764. "I1": "input",
  70765. "I2": "input",
  70766. "I3": "input",
  70767. "O": "output"
  70768. },
  70769. "connections": {
  70770. "I0": [ "0" ],
  70771. "I1": [ 3351 ],
  70772. "I2": [ 3316 ],
  70773. "I3": [ 3296 ],
  70774. "O": [ 3346 ]
  70775. }
  70776. },
  70777. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  70778. "hide_name": 0,
  70779. "type": "SB_DFFR",
  70780. "parameters": {
  70781. },
  70782. "attributes": {
  70783. "module_not_derived": "00000000000000000000000000000001",
  70784. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  70785. },
  70786. "port_directions": {
  70787. "C": "input",
  70788. "D": "input",
  70789. "Q": "output",
  70790. "R": "input"
  70791. },
  70792. "connections": {
  70793. "C": [ 42 ],
  70794. "D": [ 3203 ],
  70795. "Q": [ 3351 ],
  70796. "R": [ 127 ]
  70797. }
  70798. },
  70799. "cpu_I._zz_50__SB_LUT4_O_15": {
  70800. "hide_name": 0,
  70801. "type": "SB_LUT4",
  70802. "parameters": {
  70803. "LUT_INIT": "1111111111110000"
  70804. },
  70805. "attributes": {
  70806. "module_not_derived": "00000000000000000000000000000001",
  70807. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70808. },
  70809. "port_directions": {
  70810. "I0": "input",
  70811. "I1": "input",
  70812. "I2": "input",
  70813. "I3": "input",
  70814. "O": "output"
  70815. },
  70816. "connections": {
  70817. "I0": [ "0" ],
  70818. "I1": [ "0" ],
  70819. "I2": [ 3352 ],
  70820. "I3": [ 3353 ],
  70821. "O": [ 2270 ]
  70822. }
  70823. },
  70824. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O": {
  70825. "hide_name": 0,
  70826. "type": "SB_LUT4",
  70827. "parameters": {
  70828. "LUT_INIT": "1000000011110000"
  70829. },
  70830. "attributes": {
  70831. "module_not_derived": "00000000000000000000000000000001",
  70832. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70833. },
  70834. "port_directions": {
  70835. "I0": "input",
  70836. "I1": "input",
  70837. "I2": "input",
  70838. "I3": "input",
  70839. "O": "output"
  70840. },
  70841. "connections": {
  70842. "I0": [ 3354 ],
  70843. "I1": [ 3304 ],
  70844. "I2": [ 3355 ],
  70845. "I3": [ 3306 ],
  70846. "O": [ 3352 ]
  70847. }
  70848. },
  70849. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_1": {
  70850. "hide_name": 0,
  70851. "type": "SB_LUT4",
  70852. "parameters": {
  70853. "LUT_INIT": "1000110010000000"
  70854. },
  70855. "attributes": {
  70856. "module_not_derived": "00000000000000000000000000000001",
  70857. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70858. },
  70859. "port_directions": {
  70860. "I0": "input",
  70861. "I1": "input",
  70862. "I2": "input",
  70863. "I3": "input",
  70864. "O": "output"
  70865. },
  70866. "connections": {
  70867. "I0": [ 3356 ],
  70868. "I1": [ 3296 ],
  70869. "I2": [ 3308 ],
  70870. "I3": [ 3357 ],
  70871. "O": [ 3353 ]
  70872. }
  70873. },
  70874. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  70875. "hide_name": 0,
  70876. "type": "SB_LUT4",
  70877. "parameters": {
  70878. "LUT_INIT": "0110100110010110"
  70879. },
  70880. "attributes": {
  70881. "module_not_derived": "00000000000000000000000000000001",
  70882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  70883. },
  70884. "port_directions": {
  70885. "I0": "input",
  70886. "I1": "input",
  70887. "I2": "input",
  70888. "I3": "input",
  70889. "O": "output"
  70890. },
  70891. "connections": {
  70892. "I0": [ "0" ],
  70893. "I1": [ 3310 ],
  70894. "I2": [ 3358 ],
  70895. "I3": [ 3359 ],
  70896. "O": [ 3357 ]
  70897. }
  70898. },
  70899. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  70900. "hide_name": 0,
  70901. "type": "SB_CARRY",
  70902. "parameters": {
  70903. },
  70904. "attributes": {
  70905. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  70906. },
  70907. "port_directions": {
  70908. "CI": "input",
  70909. "CO": "output",
  70910. "I0": "input",
  70911. "I1": "input"
  70912. },
  70913. "connections": {
  70914. "CI": [ 3350 ],
  70915. "CO": [ 3359 ],
  70916. "I0": [ 3310 ],
  70917. "I1": [ 3349 ]
  70918. }
  70919. },
  70920. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  70921. "hide_name": 0,
  70922. "type": "SB_LUT4",
  70923. "parameters": {
  70924. "LUT_INIT": "0000000011111100"
  70925. },
  70926. "attributes": {
  70927. "module_not_derived": "00000000000000000000000000000001",
  70928. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  70929. },
  70930. "port_directions": {
  70931. "I0": "input",
  70932. "I1": "input",
  70933. "I2": "input",
  70934. "I3": "input",
  70935. "O": "output"
  70936. },
  70937. "connections": {
  70938. "I0": [ "0" ],
  70939. "I1": [ 3360 ],
  70940. "I2": [ 3316 ],
  70941. "I3": [ 3296 ],
  70942. "O": [ 3355 ]
  70943. }
  70944. },
  70945. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  70946. "hide_name": 0,
  70947. "type": "SB_DFFR",
  70948. "parameters": {
  70949. },
  70950. "attributes": {
  70951. "module_not_derived": "00000000000000000000000000000001",
  70952. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  70953. },
  70954. "port_directions": {
  70955. "C": "input",
  70956. "D": "input",
  70957. "Q": "output",
  70958. "R": "input"
  70959. },
  70960. "connections": {
  70961. "C": [ 42 ],
  70962. "D": [ 3189 ],
  70963. "Q": [ 3360 ],
  70964. "R": [ 127 ]
  70965. }
  70966. },
  70967. "cpu_I._zz_50__SB_LUT4_O_16": {
  70968. "hide_name": 0,
  70969. "type": "SB_LUT4",
  70970. "parameters": {
  70971. "LUT_INIT": "1111111111110000"
  70972. },
  70973. "attributes": {
  70974. "module_not_derived": "00000000000000000000000000000001",
  70975. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  70976. },
  70977. "port_directions": {
  70978. "I0": "input",
  70979. "I1": "input",
  70980. "I2": "input",
  70981. "I3": "input",
  70982. "O": "output"
  70983. },
  70984. "connections": {
  70985. "I0": [ "0" ],
  70986. "I1": [ "0" ],
  70987. "I2": [ 3361 ],
  70988. "I3": [ 3362 ],
  70989. "O": [ 2269 ]
  70990. }
  70991. },
  70992. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O": {
  70993. "hide_name": 0,
  70994. "type": "SB_LUT4",
  70995. "parameters": {
  70996. "LUT_INIT": "1000000011110000"
  70997. },
  70998. "attributes": {
  70999. "module_not_derived": "00000000000000000000000000000001",
  71000. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71001. },
  71002. "port_directions": {
  71003. "I0": "input",
  71004. "I1": "input",
  71005. "I2": "input",
  71006. "I3": "input",
  71007. "O": "output"
  71008. },
  71009. "connections": {
  71010. "I0": [ 3363 ],
  71011. "I1": [ 3304 ],
  71012. "I2": [ 3364 ],
  71013. "I3": [ 3306 ],
  71014. "O": [ 3361 ]
  71015. }
  71016. },
  71017. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_1": {
  71018. "hide_name": 0,
  71019. "type": "SB_LUT4",
  71020. "parameters": {
  71021. "LUT_INIT": "1000110010000000"
  71022. },
  71023. "attributes": {
  71024. "module_not_derived": "00000000000000000000000000000001",
  71025. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71026. },
  71027. "port_directions": {
  71028. "I0": "input",
  71029. "I1": "input",
  71030. "I2": "input",
  71031. "I3": "input",
  71032. "O": "output"
  71033. },
  71034. "connections": {
  71035. "I0": [ 3365 ],
  71036. "I1": [ 3296 ],
  71037. "I2": [ 3308 ],
  71038. "I3": [ 3366 ],
  71039. "O": [ 3362 ]
  71040. }
  71041. },
  71042. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  71043. "hide_name": 0,
  71044. "type": "SB_LUT4",
  71045. "parameters": {
  71046. "LUT_INIT": "0110100110010110"
  71047. },
  71048. "attributes": {
  71049. "module_not_derived": "00000000000000000000000000000001",
  71050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71051. },
  71052. "port_directions": {
  71053. "I0": "input",
  71054. "I1": "input",
  71055. "I2": "input",
  71056. "I3": "input",
  71057. "O": "output"
  71058. },
  71059. "connections": {
  71060. "I0": [ "0" ],
  71061. "I1": [ 3310 ],
  71062. "I2": [ 3367 ],
  71063. "I3": [ 3368 ],
  71064. "O": [ 3366 ]
  71065. }
  71066. },
  71067. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  71068. "hide_name": 0,
  71069. "type": "SB_CARRY",
  71070. "parameters": {
  71071. },
  71072. "attributes": {
  71073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  71074. },
  71075. "port_directions": {
  71076. "CI": "input",
  71077. "CO": "output",
  71078. "I0": "input",
  71079. "I1": "input"
  71080. },
  71081. "connections": {
  71082. "CI": [ 3359 ],
  71083. "CO": [ 3368 ],
  71084. "I0": [ 3310 ],
  71085. "I1": [ 3358 ]
  71086. }
  71087. },
  71088. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  71089. "hide_name": 0,
  71090. "type": "SB_LUT4",
  71091. "parameters": {
  71092. "LUT_INIT": "0000000011111100"
  71093. },
  71094. "attributes": {
  71095. "module_not_derived": "00000000000000000000000000000001",
  71096. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71097. },
  71098. "port_directions": {
  71099. "I0": "input",
  71100. "I1": "input",
  71101. "I2": "input",
  71102. "I3": "input",
  71103. "O": "output"
  71104. },
  71105. "connections": {
  71106. "I0": [ "0" ],
  71107. "I1": [ 3369 ],
  71108. "I2": [ 3316 ],
  71109. "I3": [ 3296 ],
  71110. "O": [ 3364 ]
  71111. }
  71112. },
  71113. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  71114. "hide_name": 0,
  71115. "type": "SB_DFFR",
  71116. "parameters": {
  71117. },
  71118. "attributes": {
  71119. "module_not_derived": "00000000000000000000000000000001",
  71120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71121. },
  71122. "port_directions": {
  71123. "C": "input",
  71124. "D": "input",
  71125. "Q": "output",
  71126. "R": "input"
  71127. },
  71128. "connections": {
  71129. "C": [ 42 ],
  71130. "D": [ 3172 ],
  71131. "Q": [ 3369 ],
  71132. "R": [ 127 ]
  71133. }
  71134. },
  71135. "cpu_I._zz_50__SB_LUT4_O_17": {
  71136. "hide_name": 0,
  71137. "type": "SB_LUT4",
  71138. "parameters": {
  71139. "LUT_INIT": "1111001111000000"
  71140. },
  71141. "attributes": {
  71142. "module_not_derived": "00000000000000000000000000000001",
  71143. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71144. },
  71145. "port_directions": {
  71146. "I0": "input",
  71147. "I1": "input",
  71148. "I2": "input",
  71149. "I3": "input",
  71150. "O": "output"
  71151. },
  71152. "connections": {
  71153. "I0": [ "0" ],
  71154. "I1": [ 3296 ],
  71155. "I2": [ 3370 ],
  71156. "I3": [ 3371 ],
  71157. "O": [ 2284 ]
  71158. }
  71159. },
  71160. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O": {
  71161. "hide_name": 0,
  71162. "type": "SB_LUT4",
  71163. "parameters": {
  71164. "LUT_INIT": "0000000011111100"
  71165. },
  71166. "attributes": {
  71167. "module_not_derived": "00000000000000000000000000000001",
  71168. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71169. },
  71170. "port_directions": {
  71171. "I0": "input",
  71172. "I1": "input",
  71173. "I2": "input",
  71174. "I3": "input",
  71175. "O": "output"
  71176. },
  71177. "connections": {
  71178. "I0": [ "0" ],
  71179. "I1": [ 3372 ],
  71180. "I2": [ 3316 ],
  71181. "I3": [ 3373 ],
  71182. "O": [ 3371 ]
  71183. }
  71184. },
  71185. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_1": {
  71186. "hide_name": 0,
  71187. "type": "SB_LUT4",
  71188. "parameters": {
  71189. "LUT_INIT": "1100111111000000"
  71190. },
  71191. "attributes": {
  71192. "module_not_derived": "00000000000000000000000000000001",
  71193. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71194. },
  71195. "port_directions": {
  71196. "I0": "input",
  71197. "I1": "input",
  71198. "I2": "input",
  71199. "I3": "input",
  71200. "O": "output"
  71201. },
  71202. "connections": {
  71203. "I0": [ "0" ],
  71204. "I1": [ 3374 ],
  71205. "I2": [ 3308 ],
  71206. "I3": [ 3375 ],
  71207. "O": [ 3370 ]
  71208. }
  71209. },
  71210. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  71211. "hide_name": 0,
  71212. "type": "SB_LUT4",
  71213. "parameters": {
  71214. "LUT_INIT": "0110100110010110"
  71215. },
  71216. "attributes": {
  71217. "module_not_derived": "00000000000000000000000000000001",
  71218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71219. },
  71220. "port_directions": {
  71221. "I0": "input",
  71222. "I1": "input",
  71223. "I2": "input",
  71224. "I3": "input",
  71225. "O": "output"
  71226. },
  71227. "connections": {
  71228. "I0": [ "0" ],
  71229. "I1": [ 3376 ],
  71230. "I2": [ 3377 ],
  71231. "I3": [ 3378 ],
  71232. "O": [ 3375 ]
  71233. }
  71234. },
  71235. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  71236. "hide_name": 0,
  71237. "type": "SB_CARRY",
  71238. "parameters": {
  71239. },
  71240. "attributes": {
  71241. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  71242. },
  71243. "port_directions": {
  71244. "CI": "input",
  71245. "CO": "output",
  71246. "I0": "input",
  71247. "I1": "input"
  71248. },
  71249. "connections": {
  71250. "CI": [ 3379 ],
  71251. "CO": [ 3378 ],
  71252. "I0": [ 3380 ],
  71253. "I1": [ 3381 ]
  71254. }
  71255. },
  71256. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  71257. "hide_name": 0,
  71258. "type": "SB_DFFR",
  71259. "parameters": {
  71260. },
  71261. "attributes": {
  71262. "module_not_derived": "00000000000000000000000000000001",
  71263. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71264. },
  71265. "port_directions": {
  71266. "C": "input",
  71267. "D": "input",
  71268. "Q": "output",
  71269. "R": "input"
  71270. },
  71271. "connections": {
  71272. "C": [ 42 ],
  71273. "D": [ 3251 ],
  71274. "Q": [ 3372 ],
  71275. "R": [ 127 ]
  71276. }
  71277. },
  71278. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  71279. "hide_name": 0,
  71280. "type": "SB_LUT4",
  71281. "parameters": {
  71282. "LUT_INIT": "1111001100000000"
  71283. },
  71284. "attributes": {
  71285. "module_not_derived": "00000000000000000000000000000001",
  71286. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71287. },
  71288. "port_directions": {
  71289. "I0": "input",
  71290. "I1": "input",
  71291. "I2": "input",
  71292. "I3": "input",
  71293. "O": "output"
  71294. },
  71295. "connections": {
  71296. "I0": [ "0" ],
  71297. "I1": [ 3382 ],
  71298. "I2": [ 3308 ],
  71299. "I3": [ 3383 ],
  71300. "O": [ 3373 ]
  71301. }
  71302. },
  71303. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  71304. "hide_name": 0,
  71305. "type": "SB_LUT4",
  71306. "parameters": {
  71307. "LUT_INIT": "1100110010101100"
  71308. },
  71309. "attributes": {
  71310. "module_not_derived": "00000000000000000000000000000001",
  71311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71312. },
  71313. "port_directions": {
  71314. "I0": "input",
  71315. "I1": "input",
  71316. "I2": "input",
  71317. "I3": "input",
  71318. "O": "output"
  71319. },
  71320. "connections": {
  71321. "I0": [ 3303 ],
  71322. "I1": [ 3384 ],
  71323. "I2": [ 3385 ],
  71324. "I3": [ 3386 ],
  71325. "O": [ 3382 ]
  71326. }
  71327. },
  71328. "cpu_I._zz_50__SB_LUT4_O_18": {
  71329. "hide_name": 0,
  71330. "type": "SB_LUT4",
  71331. "parameters": {
  71332. "LUT_INIT": "1111001111000000"
  71333. },
  71334. "attributes": {
  71335. "module_not_derived": "00000000000000000000000000000001",
  71336. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71337. },
  71338. "port_directions": {
  71339. "I0": "input",
  71340. "I1": "input",
  71341. "I2": "input",
  71342. "I3": "input",
  71343. "O": "output"
  71344. },
  71345. "connections": {
  71346. "I0": [ "0" ],
  71347. "I1": [ 3296 ],
  71348. "I2": [ 3387 ],
  71349. "I3": [ 3388 ],
  71350. "O": [ 2285 ]
  71351. }
  71352. },
  71353. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O": {
  71354. "hide_name": 0,
  71355. "type": "SB_LUT4",
  71356. "parameters": {
  71357. "LUT_INIT": "0000000011111100"
  71358. },
  71359. "attributes": {
  71360. "module_not_derived": "00000000000000000000000000000001",
  71361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71362. },
  71363. "port_directions": {
  71364. "I0": "input",
  71365. "I1": "input",
  71366. "I2": "input",
  71367. "I3": "input",
  71368. "O": "output"
  71369. },
  71370. "connections": {
  71371. "I0": [ "0" ],
  71372. "I1": [ 3389 ],
  71373. "I2": [ 3316 ],
  71374. "I3": [ 3390 ],
  71375. "O": [ 3388 ]
  71376. }
  71377. },
  71378. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_1": {
  71379. "hide_name": 0,
  71380. "type": "SB_LUT4",
  71381. "parameters": {
  71382. "LUT_INIT": "1100110011110000"
  71383. },
  71384. "attributes": {
  71385. "module_not_derived": "00000000000000000000000000000001",
  71386. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71387. },
  71388. "port_directions": {
  71389. "I0": "input",
  71390. "I1": "input",
  71391. "I2": "input",
  71392. "I3": "input",
  71393. "O": "output"
  71394. },
  71395. "connections": {
  71396. "I0": [ "0" ],
  71397. "I1": [ 3391 ],
  71398. "I2": [ 3392 ],
  71399. "I3": [ 3308 ],
  71400. "O": [ 3387 ]
  71401. }
  71402. },
  71403. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  71404. "hide_name": 0,
  71405. "type": "SB_LUT4",
  71406. "parameters": {
  71407. "LUT_INIT": "0110100110010110"
  71408. },
  71409. "attributes": {
  71410. "module_not_derived": "00000000000000000000000000000001",
  71411. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71412. },
  71413. "port_directions": {
  71414. "I0": "input",
  71415. "I1": "input",
  71416. "I2": "input",
  71417. "I3": "input",
  71418. "O": "output"
  71419. },
  71420. "connections": {
  71421. "I0": [ "0" ],
  71422. "I1": [ 3380 ],
  71423. "I2": [ 3381 ],
  71424. "I3": [ 3379 ],
  71425. "O": [ 3392 ]
  71426. }
  71427. },
  71428. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  71429. "hide_name": 0,
  71430. "type": "SB_CARRY",
  71431. "parameters": {
  71432. },
  71433. "attributes": {
  71434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  71435. },
  71436. "port_directions": {
  71437. "CI": "input",
  71438. "CO": "output",
  71439. "I0": "input",
  71440. "I1": "input"
  71441. },
  71442. "connections": {
  71443. "CI": [ 3393 ],
  71444. "CO": [ 3379 ],
  71445. "I0": [ 3394 ],
  71446. "I1": [ 3395 ]
  71447. }
  71448. },
  71449. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  71450. "hide_name": 0,
  71451. "type": "SB_DFFR",
  71452. "parameters": {
  71453. },
  71454. "attributes": {
  71455. "module_not_derived": "00000000000000000000000000000001",
  71456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71457. },
  71458. "port_directions": {
  71459. "C": "input",
  71460. "D": "input",
  71461. "Q": "output",
  71462. "R": "input"
  71463. },
  71464. "connections": {
  71465. "C": [ 42 ],
  71466. "D": [ 3184 ],
  71467. "Q": [ 3389 ],
  71468. "R": [ 127 ]
  71469. }
  71470. },
  71471. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  71472. "hide_name": 0,
  71473. "type": "SB_LUT4",
  71474. "parameters": {
  71475. "LUT_INIT": "1111001100000000"
  71476. },
  71477. "attributes": {
  71478. "module_not_derived": "00000000000000000000000000000001",
  71479. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71480. },
  71481. "port_directions": {
  71482. "I0": "input",
  71483. "I1": "input",
  71484. "I2": "input",
  71485. "I3": "input",
  71486. "O": "output"
  71487. },
  71488. "connections": {
  71489. "I0": [ "0" ],
  71490. "I1": [ 3396 ],
  71491. "I2": [ 3308 ],
  71492. "I3": [ 3383 ],
  71493. "O": [ 3390 ]
  71494. }
  71495. },
  71496. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  71497. "hide_name": 0,
  71498. "type": "SB_LUT4",
  71499. "parameters": {
  71500. "LUT_INIT": "1100110010101100"
  71501. },
  71502. "attributes": {
  71503. "module_not_derived": "00000000000000000000000000000001",
  71504. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71505. },
  71506. "port_directions": {
  71507. "I0": "input",
  71508. "I1": "input",
  71509. "I2": "input",
  71510. "I3": "input",
  71511. "O": "output"
  71512. },
  71513. "connections": {
  71514. "I0": [ 3397 ],
  71515. "I1": [ 3398 ],
  71516. "I2": [ 3385 ],
  71517. "I3": [ 3386 ],
  71518. "O": [ 3396 ]
  71519. }
  71520. },
  71521. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_I2": {
  71522. "hide_name": 0,
  71523. "type": "SB_LUT4",
  71524. "parameters": {
  71525. "LUT_INIT": "0000111100000000"
  71526. },
  71527. "attributes": {
  71528. "module_not_derived": "00000000000000000000000000000001",
  71529. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  71530. },
  71531. "port_directions": {
  71532. "I0": "input",
  71533. "I1": "input",
  71534. "I2": "input",
  71535. "I3": "input",
  71536. "O": "output"
  71537. },
  71538. "connections": {
  71539. "I0": [ "0" ],
  71540. "I1": [ "0" ],
  71541. "I2": [ 3399 ],
  71542. "I3": [ 3383 ],
  71543. "O": [ 3306 ]
  71544. }
  71545. },
  71546. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_LUT4_O": {
  71547. "hide_name": 0,
  71548. "type": "SB_LUT4",
  71549. "parameters": {
  71550. "LUT_INIT": "0000000011111100"
  71551. },
  71552. "attributes": {
  71553. "module_not_derived": "00000000000000000000000000000001",
  71554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71555. },
  71556. "port_directions": {
  71557. "I0": "input",
  71558. "I1": "input",
  71559. "I2": "input",
  71560. "I3": "input",
  71561. "O": "output"
  71562. },
  71563. "connections": {
  71564. "I0": [ "0" ],
  71565. "I1": [ 3400 ],
  71566. "I2": [ 3316 ],
  71567. "I3": [ 3296 ],
  71568. "O": [ 3320 ]
  71569. }
  71570. },
  71571. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  71572. "hide_name": 0,
  71573. "type": "SB_LUT4",
  71574. "parameters": {
  71575. "LUT_INIT": "0000000000010000"
  71576. },
  71577. "attributes": {
  71578. "module_not_derived": "00000000000000000000000000000001",
  71579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71580. },
  71581. "port_directions": {
  71582. "I0": "input",
  71583. "I1": "input",
  71584. "I2": "input",
  71585. "I3": "input",
  71586. "O": "output"
  71587. },
  71588. "connections": {
  71589. "I0": [ 3401 ],
  71590. "I1": [ 3304 ],
  71591. "I2": [ 3402 ],
  71592. "I3": [ 3403 ],
  71593. "O": [ 3399 ]
  71594. }
  71595. },
  71596. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_1": {
  71597. "hide_name": 0,
  71598. "type": "SB_LUT4",
  71599. "parameters": {
  71600. "LUT_INIT": "1100110010001100"
  71601. },
  71602. "attributes": {
  71603. "module_not_derived": "00000000000000000000000000000001",
  71604. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71605. },
  71606. "port_directions": {
  71607. "I0": "input",
  71608. "I1": "input",
  71609. "I2": "input",
  71610. "I3": "input",
  71611. "O": "output"
  71612. },
  71613. "connections": {
  71614. "I0": [ 3401 ],
  71615. "I1": [ 3316 ],
  71616. "I2": [ 3308 ],
  71617. "I3": [ 3404 ],
  71618. "O": [ 3383 ]
  71619. }
  71620. },
  71621. "cpu_I._zz_50__SB_LUT4_O_19": {
  71622. "hide_name": 0,
  71623. "type": "SB_LUT4",
  71624. "parameters": {
  71625. "LUT_INIT": "1111001111000000"
  71626. },
  71627. "attributes": {
  71628. "module_not_derived": "00000000000000000000000000000001",
  71629. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71630. },
  71631. "port_directions": {
  71632. "I0": "input",
  71633. "I1": "input",
  71634. "I2": "input",
  71635. "I3": "input",
  71636. "O": "output"
  71637. },
  71638. "connections": {
  71639. "I0": [ "0" ],
  71640. "I1": [ 3296 ],
  71641. "I2": [ 3405 ],
  71642. "I3": [ 3406 ],
  71643. "O": [ 2286 ]
  71644. }
  71645. },
  71646. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O": {
  71647. "hide_name": 0,
  71648. "type": "SB_LUT4",
  71649. "parameters": {
  71650. "LUT_INIT": "0000110011111100"
  71651. },
  71652. "attributes": {
  71653. "module_not_derived": "00000000000000000000000000000001",
  71654. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71655. },
  71656. "port_directions": {
  71657. "I0": "input",
  71658. "I1": "input",
  71659. "I2": "input",
  71660. "I3": "input",
  71661. "O": "output"
  71662. },
  71663. "connections": {
  71664. "I0": [ "0" ],
  71665. "I1": [ 3407 ],
  71666. "I2": [ 3316 ],
  71667. "I3": [ 3404 ],
  71668. "O": [ 3406 ]
  71669. }
  71670. },
  71671. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_1": {
  71672. "hide_name": 0,
  71673. "type": "SB_LUT4",
  71674. "parameters": {
  71675. "LUT_INIT": "1100110011110000"
  71676. },
  71677. "attributes": {
  71678. "module_not_derived": "00000000000000000000000000000001",
  71679. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71680. },
  71681. "port_directions": {
  71682. "I0": "input",
  71683. "I1": "input",
  71684. "I2": "input",
  71685. "I3": "input",
  71686. "O": "output"
  71687. },
  71688. "connections": {
  71689. "I0": [ "0" ],
  71690. "I1": [ 3408 ],
  71691. "I2": [ 3409 ],
  71692. "I3": [ 3308 ],
  71693. "O": [ 3405 ]
  71694. }
  71695. },
  71696. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  71697. "hide_name": 0,
  71698. "type": "SB_LUT4",
  71699. "parameters": {
  71700. "LUT_INIT": "0110100110010110"
  71701. },
  71702. "attributes": {
  71703. "module_not_derived": "00000000000000000000000000000001",
  71704. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71705. },
  71706. "port_directions": {
  71707. "I0": "input",
  71708. "I1": "input",
  71709. "I2": "input",
  71710. "I3": "input",
  71711. "O": "output"
  71712. },
  71713. "connections": {
  71714. "I0": [ "0" ],
  71715. "I1": [ 3394 ],
  71716. "I2": [ 3395 ],
  71717. "I3": [ 3393 ],
  71718. "O": [ 3409 ]
  71719. }
  71720. },
  71721. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  71722. "hide_name": 0,
  71723. "type": "SB_CARRY",
  71724. "parameters": {
  71725. },
  71726. "attributes": {
  71727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  71728. },
  71729. "port_directions": {
  71730. "CI": "input",
  71731. "CO": "output",
  71732. "I0": "input",
  71733. "I1": "input"
  71734. },
  71735. "connections": {
  71736. "CI": [ 3410 ],
  71737. "CO": [ 3393 ],
  71738. "I0": [ 3411 ],
  71739. "I1": [ 3412 ]
  71740. }
  71741. },
  71742. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  71743. "hide_name": 0,
  71744. "type": "SB_DFFR",
  71745. "parameters": {
  71746. },
  71747. "attributes": {
  71748. "module_not_derived": "00000000000000000000000000000001",
  71749. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71750. },
  71751. "port_directions": {
  71752. "C": "input",
  71753. "D": "input",
  71754. "Q": "output",
  71755. "R": "input"
  71756. },
  71757. "connections": {
  71758. "C": [ 42 ],
  71759. "D": [ 3246 ],
  71760. "Q": [ 3407 ],
  71761. "R": [ 127 ]
  71762. }
  71763. },
  71764. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O": {
  71765. "hide_name": 0,
  71766. "type": "SB_LUT4",
  71767. "parameters": {
  71768. "LUT_INIT": "1000000011110000"
  71769. },
  71770. "attributes": {
  71771. "module_not_derived": "00000000000000000000000000000001",
  71772. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71773. },
  71774. "port_directions": {
  71775. "I0": "input",
  71776. "I1": "input",
  71777. "I2": "input",
  71778. "I3": "input",
  71779. "O": "output"
  71780. },
  71781. "connections": {
  71782. "I0": [ 3413 ],
  71783. "I1": [ 3304 ],
  71784. "I2": [ 3414 ],
  71785. "I3": [ 3306 ],
  71786. "O": [ 3300 ]
  71787. }
  71788. },
  71789. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  71790. "hide_name": 0,
  71791. "type": "SB_LUT4",
  71792. "parameters": {
  71793. "LUT_INIT": "1000110010000000"
  71794. },
  71795. "attributes": {
  71796. "module_not_derived": "00000000000000000000000000000001",
  71797. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71798. },
  71799. "port_directions": {
  71800. "I0": "input",
  71801. "I1": "input",
  71802. "I2": "input",
  71803. "I3": "input",
  71804. "O": "output"
  71805. },
  71806. "connections": {
  71807. "I0": [ 3415 ],
  71808. "I1": [ 3296 ],
  71809. "I2": [ 3308 ],
  71810. "I3": [ 3416 ],
  71811. "O": [ 3299 ]
  71812. }
  71813. },
  71814. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  71815. "hide_name": 0,
  71816. "type": "SB_LUT4",
  71817. "parameters": {
  71818. "LUT_INIT": "0110100110010110"
  71819. },
  71820. "attributes": {
  71821. "module_not_derived": "00000000000000000000000000000001",
  71822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71823. },
  71824. "port_directions": {
  71825. "I0": "input",
  71826. "I1": "input",
  71827. "I2": "input",
  71828. "I3": "input",
  71829. "O": "output"
  71830. },
  71831. "connections": {
  71832. "I0": [ "0" ],
  71833. "I1": [ 3417 ],
  71834. "I2": [ 3418 ],
  71835. "I3": [ 3419 ],
  71836. "O": [ 3416 ]
  71837. }
  71838. },
  71839. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  71840. "hide_name": 0,
  71841. "type": "SB_CARRY",
  71842. "parameters": {
  71843. },
  71844. "attributes": {
  71845. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  71846. },
  71847. "port_directions": {
  71848. "CI": "input",
  71849. "CO": "output",
  71850. "I0": "input",
  71851. "I1": "input"
  71852. },
  71853. "connections": {
  71854. "CI": [ 3420 ],
  71855. "CO": [ 3419 ],
  71856. "I0": [ 3421 ],
  71857. "I1": [ 3422 ]
  71858. }
  71859. },
  71860. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  71861. "hide_name": 0,
  71862. "type": "SB_DFFR",
  71863. "parameters": {
  71864. },
  71865. "attributes": {
  71866. "module_not_derived": "00000000000000000000000000000001",
  71867. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71868. },
  71869. "port_directions": {
  71870. "C": "input",
  71871. "D": "input",
  71872. "Q": "output",
  71873. "R": "input"
  71874. },
  71875. "connections": {
  71876. "C": [ 42 ],
  71877. "D": [ 3423 ],
  71878. "Q": [ 3401 ],
  71879. "R": [ 127 ]
  71880. }
  71881. },
  71882. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I1_SB_DFFR_Q_1": {
  71883. "hide_name": 0,
  71884. "type": "SB_DFFR",
  71885. "parameters": {
  71886. },
  71887. "attributes": {
  71888. "module_not_derived": "00000000000000000000000000000001",
  71889. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71890. },
  71891. "port_directions": {
  71892. "C": "input",
  71893. "D": "input",
  71894. "Q": "output",
  71895. "R": "input"
  71896. },
  71897. "connections": {
  71898. "C": [ 42 ],
  71899. "D": [ 2602 ],
  71900. "Q": [ 3304 ],
  71901. "R": [ 127 ]
  71902. }
  71903. },
  71904. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I1_SB_DFFR_Q_2": {
  71905. "hide_name": 0,
  71906. "type": "SB_DFFR",
  71907. "parameters": {
  71908. },
  71909. "attributes": {
  71910. "module_not_derived": "00000000000000000000000000000001",
  71911. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71912. },
  71913. "port_directions": {
  71914. "C": "input",
  71915. "D": "input",
  71916. "Q": "output",
  71917. "R": "input"
  71918. },
  71919. "connections": {
  71920. "C": [ 42 ],
  71921. "D": [ 3424 ],
  71922. "Q": [ 3402 ],
  71923. "R": [ 127 ]
  71924. }
  71925. },
  71926. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  71927. "hide_name": 0,
  71928. "type": "SB_LUT4",
  71929. "parameters": {
  71930. "LUT_INIT": "0011001101010011"
  71931. },
  71932. "attributes": {
  71933. "module_not_derived": "00000000000000000000000000000001",
  71934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  71935. },
  71936. "port_directions": {
  71937. "I0": "input",
  71938. "I1": "input",
  71939. "I2": "input",
  71940. "I3": "input",
  71941. "O": "output"
  71942. },
  71943. "connections": {
  71944. "I0": [ 3363 ],
  71945. "I1": [ 3425 ],
  71946. "I2": [ 3385 ],
  71947. "I3": [ 3386 ],
  71948. "O": [ 3403 ]
  71949. }
  71950. },
  71951. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  71952. "hide_name": 0,
  71953. "type": "SB_LUT4",
  71954. "parameters": {
  71955. "LUT_INIT": "0000000011111100"
  71956. },
  71957. "attributes": {
  71958. "module_not_derived": "00000000000000000000000000000001",
  71959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  71960. },
  71961. "port_directions": {
  71962. "I0": "input",
  71963. "I1": "input",
  71964. "I2": "input",
  71965. "I3": "input",
  71966. "O": "output"
  71967. },
  71968. "connections": {
  71969. "I0": [ "0" ],
  71970. "I1": [ 3426 ],
  71971. "I2": [ 3316 ],
  71972. "I3": [ 3296 ],
  71973. "O": [ 3414 ]
  71974. }
  71975. },
  71976. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  71977. "hide_name": 0,
  71978. "type": "SB_DFFR",
  71979. "parameters": {
  71980. },
  71981. "attributes": {
  71982. "module_not_derived": "00000000000000000000000000000001",
  71983. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  71984. },
  71985. "port_directions": {
  71986. "C": "input",
  71987. "D": "input",
  71988. "Q": "output",
  71989. "R": "input"
  71990. },
  71991. "connections": {
  71992. "C": [ 42 ],
  71993. "D": [ 3099 ],
  71994. "Q": [ 3426 ],
  71995. "R": [ 127 ]
  71996. }
  71997. },
  71998. "cpu_I._zz_50__SB_LUT4_O_2": {
  71999. "hide_name": 0,
  72000. "type": "SB_LUT4",
  72001. "parameters": {
  72002. "LUT_INIT": "1111111111110000"
  72003. },
  72004. "attributes": {
  72005. "module_not_derived": "00000000000000000000000000000001",
  72006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  72007. },
  72008. "port_directions": {
  72009. "I0": "input",
  72010. "I1": "input",
  72011. "I2": "input",
  72012. "I3": "input",
  72013. "O": "output"
  72014. },
  72015. "connections": {
  72016. "I0": [ "0" ],
  72017. "I1": [ "0" ],
  72018. "I2": [ 3427 ],
  72019. "I3": [ 3428 ],
  72020. "O": [ 2275 ]
  72021. }
  72022. },
  72023. "cpu_I._zz_50__SB_LUT4_O_20": {
  72024. "hide_name": 0,
  72025. "type": "SB_LUT4",
  72026. "parameters": {
  72027. "LUT_INIT": "1111001111000000"
  72028. },
  72029. "attributes": {
  72030. "module_not_derived": "00000000000000000000000000000001",
  72031. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72032. },
  72033. "port_directions": {
  72034. "I0": "input",
  72035. "I1": "input",
  72036. "I2": "input",
  72037. "I3": "input",
  72038. "O": "output"
  72039. },
  72040. "connections": {
  72041. "I0": [ "0" ],
  72042. "I1": [ 3296 ],
  72043. "I2": [ 3429 ],
  72044. "I3": [ 3430 ],
  72045. "O": [ 2288 ]
  72046. }
  72047. },
  72048. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O": {
  72049. "hide_name": 0,
  72050. "type": "SB_LUT4",
  72051. "parameters": {
  72052. "LUT_INIT": "0000110011111100"
  72053. },
  72054. "attributes": {
  72055. "module_not_derived": "00000000000000000000000000000001",
  72056. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72057. },
  72058. "port_directions": {
  72059. "I0": "input",
  72060. "I1": "input",
  72061. "I2": "input",
  72062. "I3": "input",
  72063. "O": "output"
  72064. },
  72065. "connections": {
  72066. "I0": [ "0" ],
  72067. "I1": [ 3431 ],
  72068. "I2": [ 3316 ],
  72069. "I3": [ 3432 ],
  72070. "O": [ 3430 ]
  72071. }
  72072. },
  72073. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_1": {
  72074. "hide_name": 0,
  72075. "type": "SB_LUT4",
  72076. "parameters": {
  72077. "LUT_INIT": "1100110011110000"
  72078. },
  72079. "attributes": {
  72080. "module_not_derived": "00000000000000000000000000000001",
  72081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72082. },
  72083. "port_directions": {
  72084. "I0": "input",
  72085. "I1": "input",
  72086. "I2": "input",
  72087. "I3": "input",
  72088. "O": "output"
  72089. },
  72090. "connections": {
  72091. "I0": [ "0" ],
  72092. "I1": [ 3433 ],
  72093. "I2": [ 3434 ],
  72094. "I3": [ 3308 ],
  72095. "O": [ 3429 ]
  72096. }
  72097. },
  72098. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  72099. "hide_name": 0,
  72100. "type": "SB_LUT4",
  72101. "parameters": {
  72102. "LUT_INIT": "0110100110010110"
  72103. },
  72104. "attributes": {
  72105. "module_not_derived": "00000000000000000000000000000001",
  72106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72107. },
  72108. "port_directions": {
  72109. "I0": "input",
  72110. "I1": "input",
  72111. "I2": "input",
  72112. "I3": "input",
  72113. "O": "output"
  72114. },
  72115. "connections": {
  72116. "I0": [ "0" ],
  72117. "I1": [ 3435 ],
  72118. "I2": [ 3436 ],
  72119. "I3": [ 3437 ],
  72120. "O": [ 3434 ]
  72121. }
  72122. },
  72123. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  72124. "hide_name": 0,
  72125. "type": "SB_CARRY",
  72126. "parameters": {
  72127. },
  72128. "attributes": {
  72129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  72130. },
  72131. "port_directions": {
  72132. "CI": "input",
  72133. "CO": "output",
  72134. "I0": "input",
  72135. "I1": "input"
  72136. },
  72137. "connections": {
  72138. "CI": [ 3438 ],
  72139. "CO": [ 3437 ],
  72140. "I0": [ 3439 ],
  72141. "I1": [ 3440 ]
  72142. }
  72143. },
  72144. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  72145. "hide_name": 0,
  72146. "type": "SB_DFFR",
  72147. "parameters": {
  72148. },
  72149. "attributes": {
  72150. "module_not_derived": "00000000000000000000000000000001",
  72151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  72152. },
  72153. "port_directions": {
  72154. "C": "input",
  72155. "D": "input",
  72156. "Q": "output",
  72157. "R": "input"
  72158. },
  72159. "connections": {
  72160. "C": [ 42 ],
  72161. "D": [ 3164 ],
  72162. "Q": [ 3431 ],
  72163. "R": [ 127 ]
  72164. }
  72165. },
  72166. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  72167. "hide_name": 0,
  72168. "type": "SB_LUT4",
  72169. "parameters": {
  72170. "LUT_INIT": "0011111100000000"
  72171. },
  72172. "attributes": {
  72173. "module_not_derived": "00000000000000000000000000000001",
  72174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72175. },
  72176. "port_directions": {
  72177. "I0": "input",
  72178. "I1": "input",
  72179. "I2": "input",
  72180. "I3": "input",
  72181. "O": "output"
  72182. },
  72183. "connections": {
  72184. "I0": [ "0" ],
  72185. "I1": [ 3441 ],
  72186. "I2": [ 3442 ],
  72187. "I3": [ 3443 ],
  72188. "O": [ 3432 ]
  72189. }
  72190. },
  72191. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  72192. "hide_name": 0,
  72193. "type": "SB_LUT4",
  72194. "parameters": {
  72195. "LUT_INIT": "1101111100000000"
  72196. },
  72197. "attributes": {
  72198. "module_not_derived": "00000000000000000000000000000001",
  72199. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72200. },
  72201. "port_directions": {
  72202. "I0": "input",
  72203. "I1": "input",
  72204. "I2": "input",
  72205. "I3": "input",
  72206. "O": "output"
  72207. },
  72208. "connections": {
  72209. "I0": [ 3444 ],
  72210. "I1": [ 3385 ],
  72211. "I2": [ 3386 ],
  72212. "I3": [ 3445 ],
  72213. "O": [ 3443 ]
  72214. }
  72215. },
  72216. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  72217. "hide_name": 0,
  72218. "type": "SB_LUT4",
  72219. "parameters": {
  72220. "LUT_INIT": "0101111100111111"
  72221. },
  72222. "attributes": {
  72223. "module_not_derived": "00000000000000000000000000000001",
  72224. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72225. },
  72226. "port_directions": {
  72227. "I0": "input",
  72228. "I1": "input",
  72229. "I2": "input",
  72230. "I3": "input",
  72231. "O": "output"
  72232. },
  72233. "connections": {
  72234. "I0": [ 3345 ],
  72235. "I1": [ 3446 ],
  72236. "I2": [ 3385 ],
  72237. "I3": [ 3386 ],
  72238. "O": [ 3445 ]
  72239. }
  72240. },
  72241. "cpu_I._zz_50__SB_LUT4_O_21": {
  72242. "hide_name": 0,
  72243. "type": "SB_LUT4",
  72244. "parameters": {
  72245. "LUT_INIT": "1111110000110000"
  72246. },
  72247. "attributes": {
  72248. "module_not_derived": "00000000000000000000000000000001",
  72249. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72250. },
  72251. "port_directions": {
  72252. "I0": "input",
  72253. "I1": "input",
  72254. "I2": "input",
  72255. "I3": "input",
  72256. "O": "output"
  72257. },
  72258. "connections": {
  72259. "I0": [ "0" ],
  72260. "I1": [ 3296 ],
  72261. "I2": [ 3447 ],
  72262. "I3": [ 3448 ],
  72263. "O": [ 2289 ]
  72264. }
  72265. },
  72266. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O": {
  72267. "hide_name": 0,
  72268. "type": "SB_LUT4",
  72269. "parameters": {
  72270. "LUT_INIT": "0011111110101010"
  72271. },
  72272. "attributes": {
  72273. "module_not_derived": "00000000000000000000000000000001",
  72274. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72275. },
  72276. "port_directions": {
  72277. "I0": "input",
  72278. "I1": "input",
  72279. "I2": "input",
  72280. "I3": "input",
  72281. "O": "output"
  72282. },
  72283. "connections": {
  72284. "I0": [ 3449 ],
  72285. "I1": [ 3450 ],
  72286. "I2": [ 3451 ],
  72287. "I3": [ 3316 ],
  72288. "O": [ 3447 ]
  72289. }
  72290. },
  72291. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_1": {
  72292. "hide_name": 0,
  72293. "type": "SB_LUT4",
  72294. "parameters": {
  72295. "LUT_INIT": "1100110011110000"
  72296. },
  72297. "attributes": {
  72298. "module_not_derived": "00000000000000000000000000000001",
  72299. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72300. },
  72301. "port_directions": {
  72302. "I0": "input",
  72303. "I1": "input",
  72304. "I2": "input",
  72305. "I3": "input",
  72306. "O": "output"
  72307. },
  72308. "connections": {
  72309. "I0": [ "0" ],
  72310. "I1": [ 3452 ],
  72311. "I2": [ 3453 ],
  72312. "I3": [ 3308 ],
  72313. "O": [ 3448 ]
  72314. }
  72315. },
  72316. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  72317. "hide_name": 0,
  72318. "type": "SB_LUT4",
  72319. "parameters": {
  72320. "LUT_INIT": "0110100110010110"
  72321. },
  72322. "attributes": {
  72323. "module_not_derived": "00000000000000000000000000000001",
  72324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72325. },
  72326. "port_directions": {
  72327. "I0": "input",
  72328. "I1": "input",
  72329. "I2": "input",
  72330. "I3": "input",
  72331. "O": "output"
  72332. },
  72333. "connections": {
  72334. "I0": [ "0" ],
  72335. "I1": [ 3439 ],
  72336. "I2": [ 3440 ],
  72337. "I3": [ 3438 ],
  72338. "O": [ 3453 ]
  72339. }
  72340. },
  72341. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  72342. "hide_name": 0,
  72343. "type": "SB_CARRY",
  72344. "parameters": {
  72345. },
  72346. "attributes": {
  72347. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  72348. },
  72349. "port_directions": {
  72350. "CI": "input",
  72351. "CO": "output",
  72352. "I0": "input",
  72353. "I1": "input"
  72354. },
  72355. "connections": {
  72356. "CI": [ 3454 ],
  72357. "CO": [ 3438 ],
  72358. "I0": [ 3455 ],
  72359. "I1": [ 3456 ]
  72360. }
  72361. },
  72362. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_I0_SB_DFFR_Q": {
  72363. "hide_name": 0,
  72364. "type": "SB_DFFR",
  72365. "parameters": {
  72366. },
  72367. "attributes": {
  72368. "module_not_derived": "00000000000000000000000000000001",
  72369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  72370. },
  72371. "port_directions": {
  72372. "C": "input",
  72373. "D": "input",
  72374. "Q": "output",
  72375. "R": "input"
  72376. },
  72377. "connections": {
  72378. "C": [ 42 ],
  72379. "D": [ 3085 ],
  72380. "Q": [ 3449 ],
  72381. "R": [ 127 ]
  72382. }
  72383. },
  72384. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_I0_SB_LUT4_O": {
  72385. "hide_name": 0,
  72386. "type": "SB_LUT4",
  72387. "parameters": {
  72388. "LUT_INIT": "0101001111111111"
  72389. },
  72390. "attributes": {
  72391. "module_not_derived": "00000000000000000000000000000001",
  72392. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72393. },
  72394. "port_directions": {
  72395. "I0": "input",
  72396. "I1": "input",
  72397. "I2": "input",
  72398. "I3": "input",
  72399. "O": "output"
  72400. },
  72401. "connections": {
  72402. "I0": [ 3336 ],
  72403. "I1": [ 3457 ],
  72404. "I2": [ 3385 ],
  72405. "I3": [ 3386 ],
  72406. "O": [ 3450 ]
  72407. }
  72408. },
  72409. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_I0_SB_LUT4_O_1": {
  72410. "hide_name": 0,
  72411. "type": "SB_LUT4",
  72412. "parameters": {
  72413. "LUT_INIT": "1111111101010011"
  72414. },
  72415. "attributes": {
  72416. "module_not_derived": "00000000000000000000000000000001",
  72417. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72418. },
  72419. "port_directions": {
  72420. "I0": "input",
  72421. "I1": "input",
  72422. "I2": "input",
  72423. "I3": "input",
  72424. "O": "output"
  72425. },
  72426. "connections": {
  72427. "I0": [ 3458 ],
  72428. "I1": [ 3459 ],
  72429. "I2": [ 3385 ],
  72430. "I3": [ 3386 ],
  72431. "O": [ 3451 ]
  72432. }
  72433. },
  72434. "cpu_I._zz_50__SB_LUT4_O_22": {
  72435. "hide_name": 0,
  72436. "type": "SB_LUT4",
  72437. "parameters": {
  72438. "LUT_INIT": "1111110000110000"
  72439. },
  72440. "attributes": {
  72441. "module_not_derived": "00000000000000000000000000000001",
  72442. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72443. },
  72444. "port_directions": {
  72445. "I0": "input",
  72446. "I1": "input",
  72447. "I2": "input",
  72448. "I3": "input",
  72449. "O": "output"
  72450. },
  72451. "connections": {
  72452. "I0": [ "0" ],
  72453. "I1": [ 3296 ],
  72454. "I2": [ 3460 ],
  72455. "I3": [ 3461 ],
  72456. "O": [ 2290 ]
  72457. }
  72458. },
  72459. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O": {
  72460. "hide_name": 0,
  72461. "type": "SB_LUT4",
  72462. "parameters": {
  72463. "LUT_INIT": "0011111110101010"
  72464. },
  72465. "attributes": {
  72466. "module_not_derived": "00000000000000000000000000000001",
  72467. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72468. },
  72469. "port_directions": {
  72470. "I0": "input",
  72471. "I1": "input",
  72472. "I2": "input",
  72473. "I3": "input",
  72474. "O": "output"
  72475. },
  72476. "connections": {
  72477. "I0": [ 3462 ],
  72478. "I1": [ 3463 ],
  72479. "I2": [ 3464 ],
  72480. "I3": [ 3316 ],
  72481. "O": [ 3460 ]
  72482. }
  72483. },
  72484. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_1": {
  72485. "hide_name": 0,
  72486. "type": "SB_LUT4",
  72487. "parameters": {
  72488. "LUT_INIT": "1100110011110000"
  72489. },
  72490. "attributes": {
  72491. "module_not_derived": "00000000000000000000000000000001",
  72492. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72493. },
  72494. "port_directions": {
  72495. "I0": "input",
  72496. "I1": "input",
  72497. "I2": "input",
  72498. "I3": "input",
  72499. "O": "output"
  72500. },
  72501. "connections": {
  72502. "I0": [ "0" ],
  72503. "I1": [ 3465 ],
  72504. "I2": [ 3466 ],
  72505. "I3": [ 3308 ],
  72506. "O": [ 3461 ]
  72507. }
  72508. },
  72509. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  72510. "hide_name": 0,
  72511. "type": "SB_LUT4",
  72512. "parameters": {
  72513. "LUT_INIT": "0110100110010110"
  72514. },
  72515. "attributes": {
  72516. "module_not_derived": "00000000000000000000000000000001",
  72517. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72518. },
  72519. "port_directions": {
  72520. "I0": "input",
  72521. "I1": "input",
  72522. "I2": "input",
  72523. "I3": "input",
  72524. "O": "output"
  72525. },
  72526. "connections": {
  72527. "I0": [ "0" ],
  72528. "I1": [ 3455 ],
  72529. "I2": [ 3456 ],
  72530. "I3": [ 3454 ],
  72531. "O": [ 3466 ]
  72532. }
  72533. },
  72534. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  72535. "hide_name": 0,
  72536. "type": "SB_CARRY",
  72537. "parameters": {
  72538. },
  72539. "attributes": {
  72540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  72541. },
  72542. "port_directions": {
  72543. "CI": "input",
  72544. "CO": "output",
  72545. "I0": "input",
  72546. "I1": "input"
  72547. },
  72548. "connections": {
  72549. "CI": [ 3467 ],
  72550. "CO": [ 3454 ],
  72551. "I0": [ 3468 ],
  72552. "I1": [ 3469 ]
  72553. }
  72554. },
  72555. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_I0_SB_DFFR_Q": {
  72556. "hide_name": 0,
  72557. "type": "SB_DFFR",
  72558. "parameters": {
  72559. },
  72560. "attributes": {
  72561. "module_not_derived": "00000000000000000000000000000001",
  72562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  72563. },
  72564. "port_directions": {
  72565. "C": "input",
  72566. "D": "input",
  72567. "Q": "output",
  72568. "R": "input"
  72569. },
  72570. "connections": {
  72571. "C": [ 42 ],
  72572. "D": [ 3082 ],
  72573. "Q": [ 3462 ],
  72574. "R": [ 127 ]
  72575. }
  72576. },
  72577. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_I0_SB_LUT4_O": {
  72578. "hide_name": 0,
  72579. "type": "SB_LUT4",
  72580. "parameters": {
  72581. "LUT_INIT": "0101001111111111"
  72582. },
  72583. "attributes": {
  72584. "module_not_derived": "00000000000000000000000000000001",
  72585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72586. },
  72587. "port_directions": {
  72588. "I0": "input",
  72589. "I1": "input",
  72590. "I2": "input",
  72591. "I3": "input",
  72592. "O": "output"
  72593. },
  72594. "connections": {
  72595. "I0": [ 3327 ],
  72596. "I1": [ 3470 ],
  72597. "I2": [ 3385 ],
  72598. "I3": [ 3386 ],
  72599. "O": [ 3463 ]
  72600. }
  72601. },
  72602. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_I0_SB_LUT4_O_1": {
  72603. "hide_name": 0,
  72604. "type": "SB_LUT4",
  72605. "parameters": {
  72606. "LUT_INIT": "1111111101010011"
  72607. },
  72608. "attributes": {
  72609. "module_not_derived": "00000000000000000000000000000001",
  72610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72611. },
  72612. "port_directions": {
  72613. "I0": "input",
  72614. "I1": "input",
  72615. "I2": "input",
  72616. "I3": "input",
  72617. "O": "output"
  72618. },
  72619. "connections": {
  72620. "I0": [ 3471 ],
  72621. "I1": [ 3472 ],
  72622. "I2": [ 3385 ],
  72623. "I3": [ 3386 ],
  72624. "O": [ 3464 ]
  72625. }
  72626. },
  72627. "cpu_I._zz_50__SB_LUT4_O_23": {
  72628. "hide_name": 0,
  72629. "type": "SB_LUT4",
  72630. "parameters": {
  72631. "LUT_INIT": "1111001111000000"
  72632. },
  72633. "attributes": {
  72634. "module_not_derived": "00000000000000000000000000000001",
  72635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72636. },
  72637. "port_directions": {
  72638. "I0": "input",
  72639. "I1": "input",
  72640. "I2": "input",
  72641. "I3": "input",
  72642. "O": "output"
  72643. },
  72644. "connections": {
  72645. "I0": [ "0" ],
  72646. "I1": [ 3296 ],
  72647. "I2": [ 3473 ],
  72648. "I3": [ 3474 ],
  72649. "O": [ 2291 ]
  72650. }
  72651. },
  72652. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O": {
  72653. "hide_name": 0,
  72654. "type": "SB_LUT4",
  72655. "parameters": {
  72656. "LUT_INIT": "0000110011111100"
  72657. },
  72658. "attributes": {
  72659. "module_not_derived": "00000000000000000000000000000001",
  72660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72661. },
  72662. "port_directions": {
  72663. "I0": "input",
  72664. "I1": "input",
  72665. "I2": "input",
  72666. "I3": "input",
  72667. "O": "output"
  72668. },
  72669. "connections": {
  72670. "I0": [ "0" ],
  72671. "I1": [ 3475 ],
  72672. "I2": [ 3316 ],
  72673. "I3": [ 3476 ],
  72674. "O": [ 3474 ]
  72675. }
  72676. },
  72677. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_1": {
  72678. "hide_name": 0,
  72679. "type": "SB_LUT4",
  72680. "parameters": {
  72681. "LUT_INIT": "1100110011110000"
  72682. },
  72683. "attributes": {
  72684. "module_not_derived": "00000000000000000000000000000001",
  72685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72686. },
  72687. "port_directions": {
  72688. "I0": "input",
  72689. "I1": "input",
  72690. "I2": "input",
  72691. "I3": "input",
  72692. "O": "output"
  72693. },
  72694. "connections": {
  72695. "I0": [ "0" ],
  72696. "I1": [ 3477 ],
  72697. "I2": [ 3478 ],
  72698. "I3": [ 3308 ],
  72699. "O": [ 3473 ]
  72700. }
  72701. },
  72702. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  72703. "hide_name": 0,
  72704. "type": "SB_LUT4",
  72705. "parameters": {
  72706. "LUT_INIT": "0110100110010110"
  72707. },
  72708. "attributes": {
  72709. "module_not_derived": "00000000000000000000000000000001",
  72710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72711. },
  72712. "port_directions": {
  72713. "I0": "input",
  72714. "I1": "input",
  72715. "I2": "input",
  72716. "I3": "input",
  72717. "O": "output"
  72718. },
  72719. "connections": {
  72720. "I0": [ "0" ],
  72721. "I1": [ 3468 ],
  72722. "I2": [ 3469 ],
  72723. "I3": [ 3467 ],
  72724. "O": [ 3478 ]
  72725. }
  72726. },
  72727. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  72728. "hide_name": 0,
  72729. "type": "SB_CARRY",
  72730. "parameters": {
  72731. },
  72732. "attributes": {
  72733. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  72734. },
  72735. "port_directions": {
  72736. "CI": "input",
  72737. "CO": "output",
  72738. "I0": "input",
  72739. "I1": "input"
  72740. },
  72741. "connections": {
  72742. "CI": [ 3479 ],
  72743. "CO": [ 3467 ],
  72744. "I0": [ 3480 ],
  72745. "I1": [ 3481 ]
  72746. }
  72747. },
  72748. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  72749. "hide_name": 0,
  72750. "type": "SB_DFFR",
  72751. "parameters": {
  72752. },
  72753. "attributes": {
  72754. "module_not_derived": "00000000000000000000000000000001",
  72755. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  72756. },
  72757. "port_directions": {
  72758. "C": "input",
  72759. "D": "input",
  72760. "Q": "output",
  72761. "R": "input"
  72762. },
  72763. "connections": {
  72764. "C": [ 42 ],
  72765. "D": [ 3196 ],
  72766. "Q": [ 3475 ],
  72767. "R": [ 127 ]
  72768. }
  72769. },
  72770. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  72771. "hide_name": 0,
  72772. "type": "SB_LUT4",
  72773. "parameters": {
  72774. "LUT_INIT": "0011111100000000"
  72775. },
  72776. "attributes": {
  72777. "module_not_derived": "00000000000000000000000000000001",
  72778. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72779. },
  72780. "port_directions": {
  72781. "I0": "input",
  72782. "I1": "input",
  72783. "I2": "input",
  72784. "I3": "input",
  72785. "O": "output"
  72786. },
  72787. "connections": {
  72788. "I0": [ "0" ],
  72789. "I1": [ 3482 ],
  72790. "I2": [ 3442 ],
  72791. "I3": [ 3483 ],
  72792. "O": [ 3476 ]
  72793. }
  72794. },
  72795. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  72796. "hide_name": 0,
  72797. "type": "SB_LUT4",
  72798. "parameters": {
  72799. "LUT_INIT": "0111111100000000"
  72800. },
  72801. "attributes": {
  72802. "module_not_derived": "00000000000000000000000000000001",
  72803. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72804. },
  72805. "port_directions": {
  72806. "I0": "input",
  72807. "I1": "input",
  72808. "I2": "input",
  72809. "I3": "input",
  72810. "O": "output"
  72811. },
  72812. "connections": {
  72813. "I0": [ 3319 ],
  72814. "I1": [ 3385 ],
  72815. "I2": [ 3386 ],
  72816. "I3": [ 3484 ],
  72817. "O": [ 3483 ]
  72818. }
  72819. },
  72820. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  72821. "hide_name": 0,
  72822. "type": "SB_LUT4",
  72823. "parameters": {
  72824. "LUT_INIT": "1111001101011111"
  72825. },
  72826. "attributes": {
  72827. "module_not_derived": "00000000000000000000000000000001",
  72828. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72829. },
  72830. "port_directions": {
  72831. "I0": "input",
  72832. "I1": "input",
  72833. "I2": "input",
  72834. "I3": "input",
  72835. "O": "output"
  72836. },
  72837. "connections": {
  72838. "I0": [ 3485 ],
  72839. "I1": [ 3486 ],
  72840. "I2": [ 3385 ],
  72841. "I3": [ 3386 ],
  72842. "O": [ 3484 ]
  72843. }
  72844. },
  72845. "cpu_I._zz_50__SB_LUT4_O_24": {
  72846. "hide_name": 0,
  72847. "type": "SB_LUT4",
  72848. "parameters": {
  72849. "LUT_INIT": "0000000011110011"
  72850. },
  72851. "attributes": {
  72852. "module_not_derived": "00000000000000000000000000000001",
  72853. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72854. },
  72855. "port_directions": {
  72856. "I0": "input",
  72857. "I1": "input",
  72858. "I2": "input",
  72859. "I3": "input",
  72860. "O": "output"
  72861. },
  72862. "connections": {
  72863. "I0": [ "0" ],
  72864. "I1": [ 3296 ],
  72865. "I2": [ 3487 ],
  72866. "I3": [ 3488 ],
  72867. "O": [ 2293 ]
  72868. }
  72869. },
  72870. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O": {
  72871. "hide_name": 0,
  72872. "type": "SB_LUT4",
  72873. "parameters": {
  72874. "LUT_INIT": "0000110100000001"
  72875. },
  72876. "attributes": {
  72877. "module_not_derived": "00000000000000000000000000000001",
  72878. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72879. },
  72880. "port_directions": {
  72881. "I0": "input",
  72882. "I1": "input",
  72883. "I2": "input",
  72884. "I3": "input",
  72885. "O": "output"
  72886. },
  72887. "connections": {
  72888. "I0": [ 3489 ],
  72889. "I1": [ 3316 ],
  72890. "I2": [ 3296 ],
  72891. "I3": [ 3490 ],
  72892. "O": [ 3488 ]
  72893. }
  72894. },
  72895. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_1": {
  72896. "hide_name": 0,
  72897. "type": "SB_LUT4",
  72898. "parameters": {
  72899. "LUT_INIT": "1100110011110000"
  72900. },
  72901. "attributes": {
  72902. "module_not_derived": "00000000000000000000000000000001",
  72903. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72904. },
  72905. "port_directions": {
  72906. "I0": "input",
  72907. "I1": "input",
  72908. "I2": "input",
  72909. "I3": "input",
  72910. "O": "output"
  72911. },
  72912. "connections": {
  72913. "I0": [ "0" ],
  72914. "I1": [ 3491 ],
  72915. "I2": [ 3492 ],
  72916. "I3": [ 3308 ],
  72917. "O": [ 3487 ]
  72918. }
  72919. },
  72920. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  72921. "hide_name": 0,
  72922. "type": "SB_LUT4",
  72923. "parameters": {
  72924. "LUT_INIT": "0110100110010110"
  72925. },
  72926. "attributes": {
  72927. "module_not_derived": "00000000000000000000000000000001",
  72928. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  72929. },
  72930. "port_directions": {
  72931. "I0": "input",
  72932. "I1": "input",
  72933. "I2": "input",
  72934. "I3": "input",
  72935. "O": "output"
  72936. },
  72937. "connections": {
  72938. "I0": [ "0" ],
  72939. "I1": [ 3480 ],
  72940. "I2": [ 3481 ],
  72941. "I3": [ 3479 ],
  72942. "O": [ 3492 ]
  72943. }
  72944. },
  72945. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  72946. "hide_name": 0,
  72947. "type": "SB_CARRY",
  72948. "parameters": {
  72949. },
  72950. "attributes": {
  72951. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  72952. },
  72953. "port_directions": {
  72954. "CI": "input",
  72955. "CO": "output",
  72956. "I0": "input",
  72957. "I1": "input"
  72958. },
  72959. "connections": {
  72960. "CI": [ "0" ],
  72961. "CO": [ 3479 ],
  72962. "I0": [ 3493 ],
  72963. "I1": [ 3494 ]
  72964. }
  72965. },
  72966. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0_SB_DFFR_Q": {
  72967. "hide_name": 0,
  72968. "type": "SB_DFFR",
  72969. "parameters": {
  72970. },
  72971. "attributes": {
  72972. "module_not_derived": "00000000000000000000000000000001",
  72973. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  72974. },
  72975. "port_directions": {
  72976. "C": "input",
  72977. "D": "input",
  72978. "Q": "output",
  72979. "R": "input"
  72980. },
  72981. "connections": {
  72982. "C": [ 42 ],
  72983. "D": [ 3234 ],
  72984. "Q": [ 3489 ],
  72985. "R": [ 127 ]
  72986. }
  72987. },
  72988. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0_SB_LUT4_O": {
  72989. "hide_name": 0,
  72990. "type": "SB_LUT4",
  72991. "parameters": {
  72992. "LUT_INIT": "0011111100000000"
  72993. },
  72994. "attributes": {
  72995. "module_not_derived": "00000000000000000000000000000001",
  72996. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  72997. },
  72998. "port_directions": {
  72999. "I0": "input",
  73000. "I1": "input",
  73001. "I2": "input",
  73002. "I3": "input",
  73003. "O": "output"
  73004. },
  73005. "connections": {
  73006. "I0": [ "0" ],
  73007. "I1": [ 3495 ],
  73008. "I2": [ 3442 ],
  73009. "I3": [ 3496 ],
  73010. "O": [ 3490 ]
  73011. }
  73012. },
  73013. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O": {
  73014. "hide_name": 0,
  73015. "type": "SB_LUT4",
  73016. "parameters": {
  73017. "LUT_INIT": "1101111100000000"
  73018. },
  73019. "attributes": {
  73020. "module_not_derived": "00000000000000000000000000000001",
  73021. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73022. },
  73023. "port_directions": {
  73024. "I0": "input",
  73025. "I1": "input",
  73026. "I2": "input",
  73027. "I3": "input",
  73028. "O": "output"
  73029. },
  73030. "connections": {
  73031. "I0": [ 3384 ],
  73032. "I1": [ 3385 ],
  73033. "I2": [ 3386 ],
  73034. "I3": [ 3497 ],
  73035. "O": [ 3496 ]
  73036. }
  73037. },
  73038. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  73039. "hide_name": 0,
  73040. "type": "SB_LUT4",
  73041. "parameters": {
  73042. "LUT_INIT": "0101111100111111"
  73043. },
  73044. "attributes": {
  73045. "module_not_derived": "00000000000000000000000000000001",
  73046. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73047. },
  73048. "port_directions": {
  73049. "I0": "input",
  73050. "I1": "input",
  73051. "I2": "input",
  73052. "I3": "input",
  73053. "O": "output"
  73054. },
  73055. "connections": {
  73056. "I0": [ 3303 ],
  73057. "I1": [ 3498 ],
  73058. "I2": [ 3385 ],
  73059. "I3": [ 3386 ],
  73060. "O": [ 3497 ]
  73061. }
  73062. },
  73063. "cpu_I._zz_50__SB_LUT4_O_25": {
  73064. "hide_name": 0,
  73065. "type": "SB_LUT4",
  73066. "parameters": {
  73067. "LUT_INIT": "1111001111000000"
  73068. },
  73069. "attributes": {
  73070. "module_not_derived": "00000000000000000000000000000001",
  73071. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73072. },
  73073. "port_directions": {
  73074. "I0": "input",
  73075. "I1": "input",
  73076. "I2": "input",
  73077. "I3": "input",
  73078. "O": "output"
  73079. },
  73080. "connections": {
  73081. "I0": [ "0" ],
  73082. "I1": [ 3296 ],
  73083. "I2": [ 3499 ],
  73084. "I3": [ 3500 ],
  73085. "O": [ 2277 ]
  73086. }
  73087. },
  73088. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O": {
  73089. "hide_name": 0,
  73090. "type": "SB_LUT4",
  73091. "parameters": {
  73092. "LUT_INIT": "0000000011111100"
  73093. },
  73094. "attributes": {
  73095. "module_not_derived": "00000000000000000000000000000001",
  73096. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73097. },
  73098. "port_directions": {
  73099. "I0": "input",
  73100. "I1": "input",
  73101. "I2": "input",
  73102. "I3": "input",
  73103. "O": "output"
  73104. },
  73105. "connections": {
  73106. "I0": [ "0" ],
  73107. "I1": [ 3501 ],
  73108. "I2": [ 3316 ],
  73109. "I3": [ 3502 ],
  73110. "O": [ 3500 ]
  73111. }
  73112. },
  73113. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_1": {
  73114. "hide_name": 0,
  73115. "type": "SB_LUT4",
  73116. "parameters": {
  73117. "LUT_INIT": "1100111111000000"
  73118. },
  73119. "attributes": {
  73120. "module_not_derived": "00000000000000000000000000000001",
  73121. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73122. },
  73123. "port_directions": {
  73124. "I0": "input",
  73125. "I1": "input",
  73126. "I2": "input",
  73127. "I3": "input",
  73128. "O": "output"
  73129. },
  73130. "connections": {
  73131. "I0": [ "0" ],
  73132. "I1": [ 3503 ],
  73133. "I2": [ 3308 ],
  73134. "I3": [ 3504 ],
  73135. "O": [ 3499 ]
  73136. }
  73137. },
  73138. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  73139. "hide_name": 0,
  73140. "type": "SB_LUT4",
  73141. "parameters": {
  73142. "LUT_INIT": "0110100110010110"
  73143. },
  73144. "attributes": {
  73145. "module_not_derived": "00000000000000000000000000000001",
  73146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73147. },
  73148. "port_directions": {
  73149. "I0": "input",
  73150. "I1": "input",
  73151. "I2": "input",
  73152. "I3": "input",
  73153. "O": "output"
  73154. },
  73155. "connections": {
  73156. "I0": [ "0" ],
  73157. "I1": [ 3421 ],
  73158. "I2": [ 3422 ],
  73159. "I3": [ 3420 ],
  73160. "O": [ 3504 ]
  73161. }
  73162. },
  73163. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  73164. "hide_name": 0,
  73165. "type": "SB_CARRY",
  73166. "parameters": {
  73167. },
  73168. "attributes": {
  73169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  73170. },
  73171. "port_directions": {
  73172. "CI": "input",
  73173. "CO": "output",
  73174. "I0": "input",
  73175. "I1": "input"
  73176. },
  73177. "connections": {
  73178. "CI": [ 3505 ],
  73179. "CO": [ 3420 ],
  73180. "I0": [ 3506 ],
  73181. "I1": [ 3507 ]
  73182. }
  73183. },
  73184. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  73185. "hide_name": 0,
  73186. "type": "SB_DFFR",
  73187. "parameters": {
  73188. },
  73189. "attributes": {
  73190. "module_not_derived": "00000000000000000000000000000001",
  73191. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  73192. },
  73193. "port_directions": {
  73194. "C": "input",
  73195. "D": "input",
  73196. "Q": "output",
  73197. "R": "input"
  73198. },
  73199. "connections": {
  73200. "C": [ 42 ],
  73201. "D": [ 3088 ],
  73202. "Q": [ 3501 ],
  73203. "R": [ 127 ]
  73204. }
  73205. },
  73206. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  73207. "hide_name": 0,
  73208. "type": "SB_LUT4",
  73209. "parameters": {
  73210. "LUT_INIT": "1111110000000000"
  73211. },
  73212. "attributes": {
  73213. "module_not_derived": "00000000000000000000000000000001",
  73214. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73215. },
  73216. "port_directions": {
  73217. "I0": "input",
  73218. "I1": "input",
  73219. "I2": "input",
  73220. "I3": "input",
  73221. "O": "output"
  73222. },
  73223. "connections": {
  73224. "I0": [ "0" ],
  73225. "I1": [ 3403 ],
  73226. "I2": [ 3308 ],
  73227. "I3": [ 3383 ],
  73228. "O": [ 3502 ]
  73229. }
  73230. },
  73231. "cpu_I._zz_50__SB_LUT4_O_26": {
  73232. "hide_name": 0,
  73233. "type": "SB_LUT4",
  73234. "parameters": {
  73235. "LUT_INIT": "1111001111000000"
  73236. },
  73237. "attributes": {
  73238. "module_not_derived": "00000000000000000000000000000001",
  73239. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73240. },
  73241. "port_directions": {
  73242. "I0": "input",
  73243. "I1": "input",
  73244. "I2": "input",
  73245. "I3": "input",
  73246. "O": "output"
  73247. },
  73248. "connections": {
  73249. "I0": [ "0" ],
  73250. "I1": [ 3296 ],
  73251. "I2": [ 3508 ],
  73252. "I3": [ 3509 ],
  73253. "O": [ 2278 ]
  73254. }
  73255. },
  73256. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O": {
  73257. "hide_name": 0,
  73258. "type": "SB_LUT4",
  73259. "parameters": {
  73260. "LUT_INIT": "0000000011111100"
  73261. },
  73262. "attributes": {
  73263. "module_not_derived": "00000000000000000000000000000001",
  73264. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73265. },
  73266. "port_directions": {
  73267. "I0": "input",
  73268. "I1": "input",
  73269. "I2": "input",
  73270. "I3": "input",
  73271. "O": "output"
  73272. },
  73273. "connections": {
  73274. "I0": [ "0" ],
  73275. "I1": [ 3510 ],
  73276. "I2": [ 3316 ],
  73277. "I3": [ 3511 ],
  73278. "O": [ 3509 ]
  73279. }
  73280. },
  73281. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_1": {
  73282. "hide_name": 0,
  73283. "type": "SB_LUT4",
  73284. "parameters": {
  73285. "LUT_INIT": "1100111111000000"
  73286. },
  73287. "attributes": {
  73288. "module_not_derived": "00000000000000000000000000000001",
  73289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73290. },
  73291. "port_directions": {
  73292. "I0": "input",
  73293. "I1": "input",
  73294. "I2": "input",
  73295. "I3": "input",
  73296. "O": "output"
  73297. },
  73298. "connections": {
  73299. "I0": [ "0" ],
  73300. "I1": [ 3512 ],
  73301. "I2": [ 3308 ],
  73302. "I3": [ 3513 ],
  73303. "O": [ 3508 ]
  73304. }
  73305. },
  73306. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  73307. "hide_name": 0,
  73308. "type": "SB_LUT4",
  73309. "parameters": {
  73310. "LUT_INIT": "0110100110010110"
  73311. },
  73312. "attributes": {
  73313. "module_not_derived": "00000000000000000000000000000001",
  73314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73315. },
  73316. "port_directions": {
  73317. "I0": "input",
  73318. "I1": "input",
  73319. "I2": "input",
  73320. "I3": "input",
  73321. "O": "output"
  73322. },
  73323. "connections": {
  73324. "I0": [ "0" ],
  73325. "I1": [ 3506 ],
  73326. "I2": [ 3507 ],
  73327. "I3": [ 3505 ],
  73328. "O": [ 3513 ]
  73329. }
  73330. },
  73331. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  73332. "hide_name": 0,
  73333. "type": "SB_CARRY",
  73334. "parameters": {
  73335. },
  73336. "attributes": {
  73337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  73338. },
  73339. "port_directions": {
  73340. "CI": "input",
  73341. "CO": "output",
  73342. "I0": "input",
  73343. "I1": "input"
  73344. },
  73345. "connections": {
  73346. "CI": [ 3514 ],
  73347. "CO": [ 3505 ],
  73348. "I0": [ 3515 ],
  73349. "I1": [ 3516 ]
  73350. }
  73351. },
  73352. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  73353. "hide_name": 0,
  73354. "type": "SB_DFFR",
  73355. "parameters": {
  73356. },
  73357. "attributes": {
  73358. "module_not_derived": "00000000000000000000000000000001",
  73359. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  73360. },
  73361. "port_directions": {
  73362. "C": "input",
  73363. "D": "input",
  73364. "Q": "output",
  73365. "R": "input"
  73366. },
  73367. "connections": {
  73368. "C": [ 42 ],
  73369. "D": [ 3271 ],
  73370. "Q": [ 3510 ],
  73371. "R": [ 127 ]
  73372. }
  73373. },
  73374. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  73375. "hide_name": 0,
  73376. "type": "SB_LUT4",
  73377. "parameters": {
  73378. "LUT_INIT": "1111001100000000"
  73379. },
  73380. "attributes": {
  73381. "module_not_derived": "00000000000000000000000000000001",
  73382. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73383. },
  73384. "port_directions": {
  73385. "I0": "input",
  73386. "I1": "input",
  73387. "I2": "input",
  73388. "I3": "input",
  73389. "O": "output"
  73390. },
  73391. "connections": {
  73392. "I0": [ "0" ],
  73393. "I1": [ 3517 ],
  73394. "I2": [ 3308 ],
  73395. "I3": [ 3383 ],
  73396. "O": [ 3511 ]
  73397. }
  73398. },
  73399. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  73400. "hide_name": 0,
  73401. "type": "SB_LUT4",
  73402. "parameters": {
  73403. "LUT_INIT": "1100110010101100"
  73404. },
  73405. "attributes": {
  73406. "module_not_derived": "00000000000000000000000000000001",
  73407. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73408. },
  73409. "port_directions": {
  73410. "I0": "input",
  73411. "I1": "input",
  73412. "I2": "input",
  73413. "I3": "input",
  73414. "O": "output"
  73415. },
  73416. "connections": {
  73417. "I0": [ 3354 ],
  73418. "I1": [ 3518 ],
  73419. "I2": [ 3385 ],
  73420. "I3": [ 3386 ],
  73421. "O": [ 3517 ]
  73422. }
  73423. },
  73424. "cpu_I._zz_50__SB_LUT4_O_27": {
  73425. "hide_name": 0,
  73426. "type": "SB_LUT4",
  73427. "parameters": {
  73428. "LUT_INIT": "1111001111000000"
  73429. },
  73430. "attributes": {
  73431. "module_not_derived": "00000000000000000000000000000001",
  73432. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73433. },
  73434. "port_directions": {
  73435. "I0": "input",
  73436. "I1": "input",
  73437. "I2": "input",
  73438. "I3": "input",
  73439. "O": "output"
  73440. },
  73441. "connections": {
  73442. "I0": [ "0" ],
  73443. "I1": [ 3296 ],
  73444. "I2": [ 3519 ],
  73445. "I3": [ 3520 ],
  73446. "O": [ 2279 ]
  73447. }
  73448. },
  73449. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O": {
  73450. "hide_name": 0,
  73451. "type": "SB_LUT4",
  73452. "parameters": {
  73453. "LUT_INIT": "0000000011111100"
  73454. },
  73455. "attributes": {
  73456. "module_not_derived": "00000000000000000000000000000001",
  73457. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73458. },
  73459. "port_directions": {
  73460. "I0": "input",
  73461. "I1": "input",
  73462. "I2": "input",
  73463. "I3": "input",
  73464. "O": "output"
  73465. },
  73466. "connections": {
  73467. "I0": [ "0" ],
  73468. "I1": [ 3521 ],
  73469. "I2": [ 3316 ],
  73470. "I3": [ 3522 ],
  73471. "O": [ 3520 ]
  73472. }
  73473. },
  73474. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_1": {
  73475. "hide_name": 0,
  73476. "type": "SB_LUT4",
  73477. "parameters": {
  73478. "LUT_INIT": "1100111111000000"
  73479. },
  73480. "attributes": {
  73481. "module_not_derived": "00000000000000000000000000000001",
  73482. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73483. },
  73484. "port_directions": {
  73485. "I0": "input",
  73486. "I1": "input",
  73487. "I2": "input",
  73488. "I3": "input",
  73489. "O": "output"
  73490. },
  73491. "connections": {
  73492. "I0": [ "0" ],
  73493. "I1": [ 3523 ],
  73494. "I2": [ 3308 ],
  73495. "I3": [ 3524 ],
  73496. "O": [ 3519 ]
  73497. }
  73498. },
  73499. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  73500. "hide_name": 0,
  73501. "type": "SB_LUT4",
  73502. "parameters": {
  73503. "LUT_INIT": "0110100110010110"
  73504. },
  73505. "attributes": {
  73506. "module_not_derived": "00000000000000000000000000000001",
  73507. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73508. },
  73509. "port_directions": {
  73510. "I0": "input",
  73511. "I1": "input",
  73512. "I2": "input",
  73513. "I3": "input",
  73514. "O": "output"
  73515. },
  73516. "connections": {
  73517. "I0": [ "0" ],
  73518. "I1": [ 3515 ],
  73519. "I2": [ 3516 ],
  73520. "I3": [ 3514 ],
  73521. "O": [ 3524 ]
  73522. }
  73523. },
  73524. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  73525. "hide_name": 0,
  73526. "type": "SB_CARRY",
  73527. "parameters": {
  73528. },
  73529. "attributes": {
  73530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  73531. },
  73532. "port_directions": {
  73533. "CI": "input",
  73534. "CO": "output",
  73535. "I0": "input",
  73536. "I1": "input"
  73537. },
  73538. "connections": {
  73539. "CI": [ 3525 ],
  73540. "CO": [ 3514 ],
  73541. "I0": [ 3526 ],
  73542. "I1": [ 3527 ]
  73543. }
  73544. },
  73545. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  73546. "hide_name": 0,
  73547. "type": "SB_DFFR",
  73548. "parameters": {
  73549. },
  73550. "attributes": {
  73551. "module_not_derived": "00000000000000000000000000000001",
  73552. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  73553. },
  73554. "port_directions": {
  73555. "C": "input",
  73556. "D": "input",
  73557. "Q": "output",
  73558. "R": "input"
  73559. },
  73560. "connections": {
  73561. "C": [ 42 ],
  73562. "D": [ 3266 ],
  73563. "Q": [ 3521 ],
  73564. "R": [ 127 ]
  73565. }
  73566. },
  73567. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  73568. "hide_name": 0,
  73569. "type": "SB_LUT4",
  73570. "parameters": {
  73571. "LUT_INIT": "1111001100000000"
  73572. },
  73573. "attributes": {
  73574. "module_not_derived": "00000000000000000000000000000001",
  73575. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73576. },
  73577. "port_directions": {
  73578. "I0": "input",
  73579. "I1": "input",
  73580. "I2": "input",
  73581. "I3": "input",
  73582. "O": "output"
  73583. },
  73584. "connections": {
  73585. "I0": [ "0" ],
  73586. "I1": [ 3528 ],
  73587. "I2": [ 3308 ],
  73588. "I3": [ 3383 ],
  73589. "O": [ 3522 ]
  73590. }
  73591. },
  73592. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  73593. "hide_name": 0,
  73594. "type": "SB_LUT4",
  73595. "parameters": {
  73596. "LUT_INIT": "1100110010101100"
  73597. },
  73598. "attributes": {
  73599. "module_not_derived": "00000000000000000000000000000001",
  73600. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73601. },
  73602. "port_directions": {
  73603. "I0": "input",
  73604. "I1": "input",
  73605. "I2": "input",
  73606. "I3": "input",
  73607. "O": "output"
  73608. },
  73609. "connections": {
  73610. "I0": [ 3345 ],
  73611. "I1": [ 3444 ],
  73612. "I2": [ 3385 ],
  73613. "I3": [ 3386 ],
  73614. "O": [ 3528 ]
  73615. }
  73616. },
  73617. "cpu_I._zz_50__SB_LUT4_O_28": {
  73618. "hide_name": 0,
  73619. "type": "SB_LUT4",
  73620. "parameters": {
  73621. "LUT_INIT": "1111001111000000"
  73622. },
  73623. "attributes": {
  73624. "module_not_derived": "00000000000000000000000000000001",
  73625. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73626. },
  73627. "port_directions": {
  73628. "I0": "input",
  73629. "I1": "input",
  73630. "I2": "input",
  73631. "I3": "input",
  73632. "O": "output"
  73633. },
  73634. "connections": {
  73635. "I0": [ "0" ],
  73636. "I1": [ 3296 ],
  73637. "I2": [ 3529 ],
  73638. "I3": [ 3530 ],
  73639. "O": [ 2280 ]
  73640. }
  73641. },
  73642. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O": {
  73643. "hide_name": 0,
  73644. "type": "SB_LUT4",
  73645. "parameters": {
  73646. "LUT_INIT": "0000000011111100"
  73647. },
  73648. "attributes": {
  73649. "module_not_derived": "00000000000000000000000000000001",
  73650. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73651. },
  73652. "port_directions": {
  73653. "I0": "input",
  73654. "I1": "input",
  73655. "I2": "input",
  73656. "I3": "input",
  73657. "O": "output"
  73658. },
  73659. "connections": {
  73660. "I0": [ "0" ],
  73661. "I1": [ 3531 ],
  73662. "I2": [ 3316 ],
  73663. "I3": [ 3532 ],
  73664. "O": [ 3530 ]
  73665. }
  73666. },
  73667. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_1": {
  73668. "hide_name": 0,
  73669. "type": "SB_LUT4",
  73670. "parameters": {
  73671. "LUT_INIT": "1100111111000000"
  73672. },
  73673. "attributes": {
  73674. "module_not_derived": "00000000000000000000000000000001",
  73675. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73676. },
  73677. "port_directions": {
  73678. "I0": "input",
  73679. "I1": "input",
  73680. "I2": "input",
  73681. "I3": "input",
  73682. "O": "output"
  73683. },
  73684. "connections": {
  73685. "I0": [ "0" ],
  73686. "I1": [ 3533 ],
  73687. "I2": [ 3308 ],
  73688. "I3": [ 3534 ],
  73689. "O": [ 3529 ]
  73690. }
  73691. },
  73692. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  73693. "hide_name": 0,
  73694. "type": "SB_LUT4",
  73695. "parameters": {
  73696. "LUT_INIT": "0110100110010110"
  73697. },
  73698. "attributes": {
  73699. "module_not_derived": "00000000000000000000000000000001",
  73700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73701. },
  73702. "port_directions": {
  73703. "I0": "input",
  73704. "I1": "input",
  73705. "I2": "input",
  73706. "I3": "input",
  73707. "O": "output"
  73708. },
  73709. "connections": {
  73710. "I0": [ "0" ],
  73711. "I1": [ 3526 ],
  73712. "I2": [ 3527 ],
  73713. "I3": [ 3525 ],
  73714. "O": [ 3534 ]
  73715. }
  73716. },
  73717. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  73718. "hide_name": 0,
  73719. "type": "SB_CARRY",
  73720. "parameters": {
  73721. },
  73722. "attributes": {
  73723. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  73724. },
  73725. "port_directions": {
  73726. "CI": "input",
  73727. "CO": "output",
  73728. "I0": "input",
  73729. "I1": "input"
  73730. },
  73731. "connections": {
  73732. "CI": [ 3535 ],
  73733. "CO": [ 3525 ],
  73734. "I0": [ 3536 ],
  73735. "I1": [ 3537 ]
  73736. }
  73737. },
  73738. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  73739. "hide_name": 0,
  73740. "type": "SB_DFFR",
  73741. "parameters": {
  73742. },
  73743. "attributes": {
  73744. "module_not_derived": "00000000000000000000000000000001",
  73745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  73746. },
  73747. "port_directions": {
  73748. "C": "input",
  73749. "D": "input",
  73750. "Q": "output",
  73751. "R": "input"
  73752. },
  73753. "connections": {
  73754. "C": [ 42 ],
  73755. "D": [ 3261 ],
  73756. "Q": [ 3531 ],
  73757. "R": [ 127 ]
  73758. }
  73759. },
  73760. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  73761. "hide_name": 0,
  73762. "type": "SB_LUT4",
  73763. "parameters": {
  73764. "LUT_INIT": "1111001100000000"
  73765. },
  73766. "attributes": {
  73767. "module_not_derived": "00000000000000000000000000000001",
  73768. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73769. },
  73770. "port_directions": {
  73771. "I0": "input",
  73772. "I1": "input",
  73773. "I2": "input",
  73774. "I3": "input",
  73775. "O": "output"
  73776. },
  73777. "connections": {
  73778. "I0": [ "0" ],
  73779. "I1": [ 3538 ],
  73780. "I2": [ 3308 ],
  73781. "I3": [ 3383 ],
  73782. "O": [ 3532 ]
  73783. }
  73784. },
  73785. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  73786. "hide_name": 0,
  73787. "type": "SB_LUT4",
  73788. "parameters": {
  73789. "LUT_INIT": "1100110010101100"
  73790. },
  73791. "attributes": {
  73792. "module_not_derived": "00000000000000000000000000000001",
  73793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73794. },
  73795. "port_directions": {
  73796. "I0": "input",
  73797. "I1": "input",
  73798. "I2": "input",
  73799. "I3": "input",
  73800. "O": "output"
  73801. },
  73802. "connections": {
  73803. "I0": [ 3336 ],
  73804. "I1": [ 3457 ],
  73805. "I2": [ 3385 ],
  73806. "I3": [ 3386 ],
  73807. "O": [ 3538 ]
  73808. }
  73809. },
  73810. "cpu_I._zz_50__SB_LUT4_O_29": {
  73811. "hide_name": 0,
  73812. "type": "SB_LUT4",
  73813. "parameters": {
  73814. "LUT_INIT": "1111001111000000"
  73815. },
  73816. "attributes": {
  73817. "module_not_derived": "00000000000000000000000000000001",
  73818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73819. },
  73820. "port_directions": {
  73821. "I0": "input",
  73822. "I1": "input",
  73823. "I2": "input",
  73824. "I3": "input",
  73825. "O": "output"
  73826. },
  73827. "connections": {
  73828. "I0": [ "0" ],
  73829. "I1": [ 3296 ],
  73830. "I2": [ 3539 ],
  73831. "I3": [ 3540 ],
  73832. "O": [ 2282 ]
  73833. }
  73834. },
  73835. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O": {
  73836. "hide_name": 0,
  73837. "type": "SB_LUT4",
  73838. "parameters": {
  73839. "LUT_INIT": "0000000011111100"
  73840. },
  73841. "attributes": {
  73842. "module_not_derived": "00000000000000000000000000000001",
  73843. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73844. },
  73845. "port_directions": {
  73846. "I0": "input",
  73847. "I1": "input",
  73848. "I2": "input",
  73849. "I3": "input",
  73850. "O": "output"
  73851. },
  73852. "connections": {
  73853. "I0": [ "0" ],
  73854. "I1": [ 3541 ],
  73855. "I2": [ 3316 ],
  73856. "I3": [ 3542 ],
  73857. "O": [ 3540 ]
  73858. }
  73859. },
  73860. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_1": {
  73861. "hide_name": 0,
  73862. "type": "SB_LUT4",
  73863. "parameters": {
  73864. "LUT_INIT": "1100111111000000"
  73865. },
  73866. "attributes": {
  73867. "module_not_derived": "00000000000000000000000000000001",
  73868. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73869. },
  73870. "port_directions": {
  73871. "I0": "input",
  73872. "I1": "input",
  73873. "I2": "input",
  73874. "I3": "input",
  73875. "O": "output"
  73876. },
  73877. "connections": {
  73878. "I0": [ "0" ],
  73879. "I1": [ 3543 ],
  73880. "I2": [ 3308 ],
  73881. "I3": [ 3544 ],
  73882. "O": [ 3539 ]
  73883. }
  73884. },
  73885. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  73886. "hide_name": 0,
  73887. "type": "SB_LUT4",
  73888. "parameters": {
  73889. "LUT_INIT": "0110100110010110"
  73890. },
  73891. "attributes": {
  73892. "module_not_derived": "00000000000000000000000000000001",
  73893. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73894. },
  73895. "port_directions": {
  73896. "I0": "input",
  73897. "I1": "input",
  73898. "I2": "input",
  73899. "I3": "input",
  73900. "O": "output"
  73901. },
  73902. "connections": {
  73903. "I0": [ "0" ],
  73904. "I1": [ 3536 ],
  73905. "I2": [ 3537 ],
  73906. "I3": [ 3535 ],
  73907. "O": [ 3544 ]
  73908. }
  73909. },
  73910. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  73911. "hide_name": 0,
  73912. "type": "SB_CARRY",
  73913. "parameters": {
  73914. },
  73915. "attributes": {
  73916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  73917. },
  73918. "port_directions": {
  73919. "CI": "input",
  73920. "CO": "output",
  73921. "I0": "input",
  73922. "I1": "input"
  73923. },
  73924. "connections": {
  73925. "CI": [ 3545 ],
  73926. "CO": [ 3535 ],
  73927. "I0": [ 3546 ],
  73928. "I1": [ 3547 ]
  73929. }
  73930. },
  73931. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  73932. "hide_name": 0,
  73933. "type": "SB_DFFR",
  73934. "parameters": {
  73935. },
  73936. "attributes": {
  73937. "module_not_derived": "00000000000000000000000000000001",
  73938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  73939. },
  73940. "port_directions": {
  73941. "C": "input",
  73942. "D": "input",
  73943. "Q": "output",
  73944. "R": "input"
  73945. },
  73946. "connections": {
  73947. "C": [ 42 ],
  73948. "D": [ 3256 ],
  73949. "Q": [ 3541 ],
  73950. "R": [ 127 ]
  73951. }
  73952. },
  73953. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  73954. "hide_name": 0,
  73955. "type": "SB_LUT4",
  73956. "parameters": {
  73957. "LUT_INIT": "1111001100000000"
  73958. },
  73959. "attributes": {
  73960. "module_not_derived": "00000000000000000000000000000001",
  73961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  73962. },
  73963. "port_directions": {
  73964. "I0": "input",
  73965. "I1": "input",
  73966. "I2": "input",
  73967. "I3": "input",
  73968. "O": "output"
  73969. },
  73970. "connections": {
  73971. "I0": [ "0" ],
  73972. "I1": [ 3548 ],
  73973. "I2": [ 3308 ],
  73974. "I3": [ 3383 ],
  73975. "O": [ 3542 ]
  73976. }
  73977. },
  73978. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  73979. "hide_name": 0,
  73980. "type": "SB_LUT4",
  73981. "parameters": {
  73982. "LUT_INIT": "1100110010101100"
  73983. },
  73984. "attributes": {
  73985. "module_not_derived": "00000000000000000000000000000001",
  73986. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  73987. },
  73988. "port_directions": {
  73989. "I0": "input",
  73990. "I1": "input",
  73991. "I2": "input",
  73992. "I3": "input",
  73993. "O": "output"
  73994. },
  73995. "connections": {
  73996. "I0": [ 3327 ],
  73997. "I1": [ 3470 ],
  73998. "I2": [ 3385 ],
  73999. "I3": [ 3386 ],
  74000. "O": [ 3548 ]
  74001. }
  74002. },
  74003. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O": {
  74004. "hide_name": 0,
  74005. "type": "SB_LUT4",
  74006. "parameters": {
  74007. "LUT_INIT": "1000000011110000"
  74008. },
  74009. "attributes": {
  74010. "module_not_derived": "00000000000000000000000000000001",
  74011. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74012. },
  74013. "port_directions": {
  74014. "I0": "input",
  74015. "I1": "input",
  74016. "I2": "input",
  74017. "I3": "input",
  74018. "O": "output"
  74019. },
  74020. "connections": {
  74021. "I0": [ 3498 ],
  74022. "I1": [ 3304 ],
  74023. "I2": [ 3549 ],
  74024. "I3": [ 3306 ],
  74025. "O": [ 3428 ]
  74026. }
  74027. },
  74028. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_1": {
  74029. "hide_name": 0,
  74030. "type": "SB_LUT4",
  74031. "parameters": {
  74032. "LUT_INIT": "1000110010000000"
  74033. },
  74034. "attributes": {
  74035. "module_not_derived": "00000000000000000000000000000001",
  74036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74037. },
  74038. "port_directions": {
  74039. "I0": "input",
  74040. "I1": "input",
  74041. "I2": "input",
  74042. "I3": "input",
  74043. "O": "output"
  74044. },
  74045. "connections": {
  74046. "I0": [ 3550 ],
  74047. "I1": [ 3296 ],
  74048. "I2": [ 3308 ],
  74049. "I3": [ 3551 ],
  74050. "O": [ 3427 ]
  74051. }
  74052. },
  74053. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  74054. "hide_name": 0,
  74055. "type": "SB_LUT4",
  74056. "parameters": {
  74057. "LUT_INIT": "0110100110010110"
  74058. },
  74059. "attributes": {
  74060. "module_not_derived": "00000000000000000000000000000001",
  74061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74062. },
  74063. "port_directions": {
  74064. "I0": "input",
  74065. "I1": "input",
  74066. "I2": "input",
  74067. "I3": "input",
  74068. "O": "output"
  74069. },
  74070. "connections": {
  74071. "I0": [ "0" ],
  74072. "I1": [ 3552 ],
  74073. "I2": [ 3553 ],
  74074. "I3": [ 3554 ],
  74075. "O": [ 3551 ]
  74076. }
  74077. },
  74078. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  74079. "hide_name": 0,
  74080. "type": "SB_CARRY",
  74081. "parameters": {
  74082. },
  74083. "attributes": {
  74084. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  74085. },
  74086. "port_directions": {
  74087. "CI": "input",
  74088. "CO": "output",
  74089. "I0": "input",
  74090. "I1": "input"
  74091. },
  74092. "connections": {
  74093. "CI": [ 3419 ],
  74094. "CO": [ 3554 ],
  74095. "I0": [ 3417 ],
  74096. "I1": [ 3418 ]
  74097. }
  74098. },
  74099. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  74100. "hide_name": 0,
  74101. "type": "SB_LUT4",
  74102. "parameters": {
  74103. "LUT_INIT": "0000000011111100"
  74104. },
  74105. "attributes": {
  74106. "module_not_derived": "00000000000000000000000000000001",
  74107. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74108. },
  74109. "port_directions": {
  74110. "I0": "input",
  74111. "I1": "input",
  74112. "I2": "input",
  74113. "I3": "input",
  74114. "O": "output"
  74115. },
  74116. "connections": {
  74117. "I0": [ "0" ],
  74118. "I1": [ 3555 ],
  74119. "I2": [ 3316 ],
  74120. "I3": [ 3296 ],
  74121. "O": [ 3549 ]
  74122. }
  74123. },
  74124. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  74125. "hide_name": 0,
  74126. "type": "SB_DFFR",
  74127. "parameters": {
  74128. },
  74129. "attributes": {
  74130. "module_not_derived": "00000000000000000000000000000001",
  74131. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  74132. },
  74133. "port_directions": {
  74134. "C": "input",
  74135. "D": "input",
  74136. "Q": "output",
  74137. "R": "input"
  74138. },
  74139. "connections": {
  74140. "C": [ 42 ],
  74141. "D": [ 3104 ],
  74142. "Q": [ 3555 ],
  74143. "R": [ 127 ]
  74144. }
  74145. },
  74146. "cpu_I._zz_50__SB_LUT4_O_3": {
  74147. "hide_name": 0,
  74148. "type": "SB_LUT4",
  74149. "parameters": {
  74150. "LUT_INIT": "1111111111110000"
  74151. },
  74152. "attributes": {
  74153. "module_not_derived": "00000000000000000000000000000001",
  74154. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  74155. },
  74156. "port_directions": {
  74157. "I0": "input",
  74158. "I1": "input",
  74159. "I2": "input",
  74160. "I3": "input",
  74161. "O": "output"
  74162. },
  74163. "connections": {
  74164. "I0": [ "0" ],
  74165. "I1": [ "0" ],
  74166. "I2": [ 3556 ],
  74167. "I3": [ 3557 ],
  74168. "O": [ 2274 ]
  74169. }
  74170. },
  74171. "cpu_I._zz_50__SB_LUT4_O_30": {
  74172. "hide_name": 0,
  74173. "type": "SB_LUT4",
  74174. "parameters": {
  74175. "LUT_INIT": "1111001111000000"
  74176. },
  74177. "attributes": {
  74178. "module_not_derived": "00000000000000000000000000000001",
  74179. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74180. },
  74181. "port_directions": {
  74182. "I0": "input",
  74183. "I1": "input",
  74184. "I2": "input",
  74185. "I3": "input",
  74186. "O": "output"
  74187. },
  74188. "connections": {
  74189. "I0": [ "0" ],
  74190. "I1": [ 3296 ],
  74191. "I2": [ 3558 ],
  74192. "I3": [ 3559 ],
  74193. "O": [ 2283 ]
  74194. }
  74195. },
  74196. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O": {
  74197. "hide_name": 0,
  74198. "type": "SB_LUT4",
  74199. "parameters": {
  74200. "LUT_INIT": "0000000011111100"
  74201. },
  74202. "attributes": {
  74203. "module_not_derived": "00000000000000000000000000000001",
  74204. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74205. },
  74206. "port_directions": {
  74207. "I0": "input",
  74208. "I1": "input",
  74209. "I2": "input",
  74210. "I3": "input",
  74211. "O": "output"
  74212. },
  74213. "connections": {
  74214. "I0": [ "0" ],
  74215. "I1": [ 3560 ],
  74216. "I2": [ 3316 ],
  74217. "I3": [ 3561 ],
  74218. "O": [ 3559 ]
  74219. }
  74220. },
  74221. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_1": {
  74222. "hide_name": 0,
  74223. "type": "SB_LUT4",
  74224. "parameters": {
  74225. "LUT_INIT": "1100111111000000"
  74226. },
  74227. "attributes": {
  74228. "module_not_derived": "00000000000000000000000000000001",
  74229. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74230. },
  74231. "port_directions": {
  74232. "I0": "input",
  74233. "I1": "input",
  74234. "I2": "input",
  74235. "I3": "input",
  74236. "O": "output"
  74237. },
  74238. "connections": {
  74239. "I0": [ "0" ],
  74240. "I1": [ 3562 ],
  74241. "I2": [ 3308 ],
  74242. "I3": [ 3563 ],
  74243. "O": [ 3558 ]
  74244. }
  74245. },
  74246. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  74247. "hide_name": 0,
  74248. "type": "SB_LUT4",
  74249. "parameters": {
  74250. "LUT_INIT": "0110100110010110"
  74251. },
  74252. "attributes": {
  74253. "module_not_derived": "00000000000000000000000000000001",
  74254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74255. },
  74256. "port_directions": {
  74257. "I0": "input",
  74258. "I1": "input",
  74259. "I2": "input",
  74260. "I3": "input",
  74261. "O": "output"
  74262. },
  74263. "connections": {
  74264. "I0": [ "0" ],
  74265. "I1": [ 3546 ],
  74266. "I2": [ 3547 ],
  74267. "I3": [ 3545 ],
  74268. "O": [ 3563 ]
  74269. }
  74270. },
  74271. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  74272. "hide_name": 0,
  74273. "type": "SB_CARRY",
  74274. "parameters": {
  74275. },
  74276. "attributes": {
  74277. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  74278. },
  74279. "port_directions": {
  74280. "CI": "input",
  74281. "CO": "output",
  74282. "I0": "input",
  74283. "I1": "input"
  74284. },
  74285. "connections": {
  74286. "CI": [ 3378 ],
  74287. "CO": [ 3545 ],
  74288. "I0": [ 3376 ],
  74289. "I1": [ 3377 ]
  74290. }
  74291. },
  74292. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  74293. "hide_name": 0,
  74294. "type": "SB_DFFR",
  74295. "parameters": {
  74296. },
  74297. "attributes": {
  74298. "module_not_derived": "00000000000000000000000000000001",
  74299. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  74300. },
  74301. "port_directions": {
  74302. "C": "input",
  74303. "D": "input",
  74304. "Q": "output",
  74305. "R": "input"
  74306. },
  74307. "connections": {
  74308. "C": [ 42 ],
  74309. "D": [ 3239 ],
  74310. "Q": [ 3560 ],
  74311. "R": [ 127 ]
  74312. }
  74313. },
  74314. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  74315. "hide_name": 0,
  74316. "type": "SB_LUT4",
  74317. "parameters": {
  74318. "LUT_INIT": "1111001100000000"
  74319. },
  74320. "attributes": {
  74321. "module_not_derived": "00000000000000000000000000000001",
  74322. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74323. },
  74324. "port_directions": {
  74325. "I0": "input",
  74326. "I1": "input",
  74327. "I2": "input",
  74328. "I3": "input",
  74329. "O": "output"
  74330. },
  74331. "connections": {
  74332. "I0": [ "0" ],
  74333. "I1": [ 3564 ],
  74334. "I2": [ 3308 ],
  74335. "I3": [ 3383 ],
  74336. "O": [ 3561 ]
  74337. }
  74338. },
  74339. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  74340. "hide_name": 0,
  74341. "type": "SB_LUT4",
  74342. "parameters": {
  74343. "LUT_INIT": "1100110010101100"
  74344. },
  74345. "attributes": {
  74346. "module_not_derived": "00000000000000000000000000000001",
  74347. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74348. },
  74349. "port_directions": {
  74350. "I0": "input",
  74351. "I1": "input",
  74352. "I2": "input",
  74353. "I3": "input",
  74354. "O": "output"
  74355. },
  74356. "connections": {
  74357. "I0": [ 3319 ],
  74358. "I1": [ 3486 ],
  74359. "I2": [ 3385 ],
  74360. "I3": [ 3386 ],
  74361. "O": [ 3564 ]
  74362. }
  74363. },
  74364. "cpu_I._zz_50__SB_LUT4_O_31": {
  74365. "hide_name": 0,
  74366. "type": "SB_LUT4",
  74367. "parameters": {
  74368. "LUT_INIT": "0000000000001111"
  74369. },
  74370. "attributes": {
  74371. "module_not_derived": "00000000000000000000000000000001",
  74372. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  74373. },
  74374. "port_directions": {
  74375. "I0": "input",
  74376. "I1": "input",
  74377. "I2": "input",
  74378. "I3": "input",
  74379. "O": "output"
  74380. },
  74381. "connections": {
  74382. "I0": [ "0" ],
  74383. "I1": [ "0" ],
  74384. "I2": [ 3565 ],
  74385. "I3": [ 3566 ],
  74386. "O": [ 2294 ]
  74387. }
  74388. },
  74389. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O": {
  74390. "hide_name": 0,
  74391. "type": "SB_LUT4",
  74392. "parameters": {
  74393. "LUT_INIT": "0000110100000001"
  74394. },
  74395. "attributes": {
  74396. "module_not_derived": "00000000000000000000000000000001",
  74397. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74398. },
  74399. "port_directions": {
  74400. "I0": "input",
  74401. "I1": "input",
  74402. "I2": "input",
  74403. "I3": "input",
  74404. "O": "output"
  74405. },
  74406. "connections": {
  74407. "I0": [ 3567 ],
  74408. "I1": [ 3316 ],
  74409. "I2": [ 3296 ],
  74410. "I3": [ 3568 ],
  74411. "O": [ 3566 ]
  74412. }
  74413. },
  74414. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_1": {
  74415. "hide_name": 0,
  74416. "type": "SB_LUT4",
  74417. "parameters": {
  74418. "LUT_INIT": "0101000000110000"
  74419. },
  74420. "attributes": {
  74421. "module_not_derived": "00000000000000000000000000000001",
  74422. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74423. },
  74424. "port_directions": {
  74425. "I0": "input",
  74426. "I1": "input",
  74427. "I2": "input",
  74428. "I3": "input",
  74429. "O": "output"
  74430. },
  74431. "connections": {
  74432. "I0": [ 3569 ],
  74433. "I1": [ 3570 ],
  74434. "I2": [ 3296 ],
  74435. "I3": [ 3308 ],
  74436. "O": [ 3565 ]
  74437. }
  74438. },
  74439. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_1_I1_SB_LUT4_O": {
  74440. "hide_name": 0,
  74441. "type": "SB_LUT4",
  74442. "parameters": {
  74443. "LUT_INIT": "0110100110010110"
  74444. },
  74445. "attributes": {
  74446. "module_not_derived": "00000000000000000000000000000001",
  74447. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74448. },
  74449. "port_directions": {
  74450. "I0": "input",
  74451. "I1": "input",
  74452. "I2": "input",
  74453. "I3": "input",
  74454. "O": "output"
  74455. },
  74456. "connections": {
  74457. "I0": [ "0" ],
  74458. "I1": [ 3493 ],
  74459. "I2": [ 3494 ],
  74460. "I3": [ "0" ],
  74461. "O": [ 3570 ]
  74462. }
  74463. },
  74464. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0_SB_DFFR_Q": {
  74465. "hide_name": 0,
  74466. "type": "SB_DFFR",
  74467. "parameters": {
  74468. },
  74469. "attributes": {
  74470. "module_not_derived": "00000000000000000000000000000001",
  74471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  74472. },
  74473. "port_directions": {
  74474. "C": "input",
  74475. "D": "input",
  74476. "Q": "output",
  74477. "R": "input"
  74478. },
  74479. "connections": {
  74480. "C": [ 42 ],
  74481. "D": [ 3179 ],
  74482. "Q": [ 3567 ],
  74483. "R": [ 127 ]
  74484. }
  74485. },
  74486. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0_SB_LUT4_O": {
  74487. "hide_name": 0,
  74488. "type": "SB_LUT4",
  74489. "parameters": {
  74490. "LUT_INIT": "0011111100000000"
  74491. },
  74492. "attributes": {
  74493. "module_not_derived": "00000000000000000000000000000001",
  74494. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74495. },
  74496. "port_directions": {
  74497. "I0": "input",
  74498. "I1": "input",
  74499. "I2": "input",
  74500. "I3": "input",
  74501. "O": "output"
  74502. },
  74503. "connections": {
  74504. "I0": [ "0" ],
  74505. "I1": [ 3571 ],
  74506. "I2": [ 3442 ],
  74507. "I3": [ 3572 ],
  74508. "O": [ 3568 ]
  74509. }
  74510. },
  74511. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O": {
  74512. "hide_name": 0,
  74513. "type": "SB_LUT4",
  74514. "parameters": {
  74515. "LUT_INIT": "1101111100000000"
  74516. },
  74517. "attributes": {
  74518. "module_not_derived": "00000000000000000000000000000001",
  74519. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74520. },
  74521. "port_directions": {
  74522. "I0": "input",
  74523. "I1": "input",
  74524. "I2": "input",
  74525. "I3": "input",
  74526. "O": "output"
  74527. },
  74528. "connections": {
  74529. "I0": [ 3398 ],
  74530. "I1": [ 3385 ],
  74531. "I2": [ 3386 ],
  74532. "I3": [ 3573 ],
  74533. "O": [ 3572 ]
  74534. }
  74535. },
  74536. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  74537. "hide_name": 0,
  74538. "type": "SB_LUT4",
  74539. "parameters": {
  74540. "LUT_INIT": "0101111100111111"
  74541. },
  74542. "attributes": {
  74543. "module_not_derived": "00000000000000000000000000000001",
  74544. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74545. },
  74546. "port_directions": {
  74547. "I0": "input",
  74548. "I1": "input",
  74549. "I2": "input",
  74550. "I3": "input",
  74551. "O": "output"
  74552. },
  74553. "connections": {
  74554. "I0": [ 3397 ],
  74555. "I1": [ 3413 ],
  74556. "I2": [ 3385 ],
  74557. "I3": [ 3386 ],
  74558. "O": [ 3573 ]
  74559. }
  74560. },
  74561. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O": {
  74562. "hide_name": 0,
  74563. "type": "SB_LUT4",
  74564. "parameters": {
  74565. "LUT_INIT": "1000000011110000"
  74566. },
  74567. "attributes": {
  74568. "module_not_derived": "00000000000000000000000000000001",
  74569. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74570. },
  74571. "port_directions": {
  74572. "I0": "input",
  74573. "I1": "input",
  74574. "I2": "input",
  74575. "I3": "input",
  74576. "O": "output"
  74577. },
  74578. "connections": {
  74579. "I0": [ 3485 ],
  74580. "I1": [ 3304 ],
  74581. "I2": [ 3574 ],
  74582. "I3": [ 3306 ],
  74583. "O": [ 3557 ]
  74584. }
  74585. },
  74586. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_1": {
  74587. "hide_name": 0,
  74588. "type": "SB_LUT4",
  74589. "parameters": {
  74590. "LUT_INIT": "1000110010000000"
  74591. },
  74592. "attributes": {
  74593. "module_not_derived": "00000000000000000000000000000001",
  74594. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74595. },
  74596. "port_directions": {
  74597. "I0": "input",
  74598. "I1": "input",
  74599. "I2": "input",
  74600. "I3": "input",
  74601. "O": "output"
  74602. },
  74603. "connections": {
  74604. "I0": [ 3575 ],
  74605. "I1": [ 3296 ],
  74606. "I2": [ 3308 ],
  74607. "I3": [ 3576 ],
  74608. "O": [ 3556 ]
  74609. }
  74610. },
  74611. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  74612. "hide_name": 0,
  74613. "type": "SB_LUT4",
  74614. "parameters": {
  74615. "LUT_INIT": "0110100110010110"
  74616. },
  74617. "attributes": {
  74618. "module_not_derived": "00000000000000000000000000000001",
  74619. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74620. },
  74621. "port_directions": {
  74622. "I0": "input",
  74623. "I1": "input",
  74624. "I2": "input",
  74625. "I3": "input",
  74626. "O": "output"
  74627. },
  74628. "connections": {
  74629. "I0": [ "0" ],
  74630. "I1": [ 3577 ],
  74631. "I2": [ 3578 ],
  74632. "I3": [ 3579 ],
  74633. "O": [ 3576 ]
  74634. }
  74635. },
  74636. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  74637. "hide_name": 0,
  74638. "type": "SB_CARRY",
  74639. "parameters": {
  74640. },
  74641. "attributes": {
  74642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  74643. },
  74644. "port_directions": {
  74645. "CI": "input",
  74646. "CO": "output",
  74647. "I0": "input",
  74648. "I1": "input"
  74649. },
  74650. "connections": {
  74651. "CI": [ 3554 ],
  74652. "CO": [ 3579 ],
  74653. "I0": [ 3552 ],
  74654. "I1": [ 3553 ]
  74655. }
  74656. },
  74657. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  74658. "hide_name": 0,
  74659. "type": "SB_LUT4",
  74660. "parameters": {
  74661. "LUT_INIT": "0000000011111100"
  74662. },
  74663. "attributes": {
  74664. "module_not_derived": "00000000000000000000000000000001",
  74665. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74666. },
  74667. "port_directions": {
  74668. "I0": "input",
  74669. "I1": "input",
  74670. "I2": "input",
  74671. "I3": "input",
  74672. "O": "output"
  74673. },
  74674. "connections": {
  74675. "I0": [ "0" ],
  74676. "I1": [ 3580 ],
  74677. "I2": [ 3316 ],
  74678. "I3": [ 3296 ],
  74679. "O": [ 3574 ]
  74680. }
  74681. },
  74682. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  74683. "hide_name": 0,
  74684. "type": "SB_DFFR",
  74685. "parameters": {
  74686. },
  74687. "attributes": {
  74688. "module_not_derived": "00000000000000000000000000000001",
  74689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  74690. },
  74691. "port_directions": {
  74692. "C": "input",
  74693. "D": "input",
  74694. "Q": "output",
  74695. "R": "input"
  74696. },
  74697. "connections": {
  74698. "C": [ 42 ],
  74699. "D": [ 3111 ],
  74700. "Q": [ 3580 ],
  74701. "R": [ 127 ]
  74702. }
  74703. },
  74704. "cpu_I._zz_50__SB_LUT4_O_4": {
  74705. "hide_name": 0,
  74706. "type": "SB_LUT4",
  74707. "parameters": {
  74708. "LUT_INIT": "1111111111110000"
  74709. },
  74710. "attributes": {
  74711. "module_not_derived": "00000000000000000000000000000001",
  74712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  74713. },
  74714. "port_directions": {
  74715. "I0": "input",
  74716. "I1": "input",
  74717. "I2": "input",
  74718. "I3": "input",
  74719. "O": "output"
  74720. },
  74721. "connections": {
  74722. "I0": [ "0" ],
  74723. "I1": [ "0" ],
  74724. "I2": [ 3581 ],
  74725. "I3": [ 3582 ],
  74726. "O": [ 2273 ]
  74727. }
  74728. },
  74729. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O": {
  74730. "hide_name": 0,
  74731. "type": "SB_LUT4",
  74732. "parameters": {
  74733. "LUT_INIT": "1000000011110000"
  74734. },
  74735. "attributes": {
  74736. "module_not_derived": "00000000000000000000000000000001",
  74737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74738. },
  74739. "port_directions": {
  74740. "I0": "input",
  74741. "I1": "input",
  74742. "I2": "input",
  74743. "I3": "input",
  74744. "O": "output"
  74745. },
  74746. "connections": {
  74747. "I0": [ 3471 ],
  74748. "I1": [ 3304 ],
  74749. "I2": [ 3583 ],
  74750. "I3": [ 3306 ],
  74751. "O": [ 3582 ]
  74752. }
  74753. },
  74754. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_1": {
  74755. "hide_name": 0,
  74756. "type": "SB_LUT4",
  74757. "parameters": {
  74758. "LUT_INIT": "1000110010000000"
  74759. },
  74760. "attributes": {
  74761. "module_not_derived": "00000000000000000000000000000001",
  74762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74763. },
  74764. "port_directions": {
  74765. "I0": "input",
  74766. "I1": "input",
  74767. "I2": "input",
  74768. "I3": "input",
  74769. "O": "output"
  74770. },
  74771. "connections": {
  74772. "I0": [ 3584 ],
  74773. "I1": [ 3296 ],
  74774. "I2": [ 3308 ],
  74775. "I3": [ 3585 ],
  74776. "O": [ 3581 ]
  74777. }
  74778. },
  74779. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  74780. "hide_name": 0,
  74781. "type": "SB_LUT4",
  74782. "parameters": {
  74783. "LUT_INIT": "0110100110010110"
  74784. },
  74785. "attributes": {
  74786. "module_not_derived": "00000000000000000000000000000001",
  74787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74788. },
  74789. "port_directions": {
  74790. "I0": "input",
  74791. "I1": "input",
  74792. "I2": "input",
  74793. "I3": "input",
  74794. "O": "output"
  74795. },
  74796. "connections": {
  74797. "I0": [ "0" ],
  74798. "I1": [ 3310 ],
  74799. "I2": [ 3586 ],
  74800. "I3": [ 3587 ],
  74801. "O": [ 3585 ]
  74802. }
  74803. },
  74804. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  74805. "hide_name": 0,
  74806. "type": "SB_CARRY",
  74807. "parameters": {
  74808. },
  74809. "attributes": {
  74810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  74811. },
  74812. "port_directions": {
  74813. "CI": "input",
  74814. "CO": "output",
  74815. "I0": "input",
  74816. "I1": "input"
  74817. },
  74818. "connections": {
  74819. "CI": [ 3579 ],
  74820. "CO": [ 3587 ],
  74821. "I0": [ 3577 ],
  74822. "I1": [ 3578 ]
  74823. }
  74824. },
  74825. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  74826. "hide_name": 0,
  74827. "type": "SB_LUT4",
  74828. "parameters": {
  74829. "LUT_INIT": "0000000011111100"
  74830. },
  74831. "attributes": {
  74832. "module_not_derived": "00000000000000000000000000000001",
  74833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  74834. },
  74835. "port_directions": {
  74836. "I0": "input",
  74837. "I1": "input",
  74838. "I2": "input",
  74839. "I3": "input",
  74840. "O": "output"
  74841. },
  74842. "connections": {
  74843. "I0": [ "0" ],
  74844. "I1": [ 3588 ],
  74845. "I2": [ 3316 ],
  74846. "I3": [ 3296 ],
  74847. "O": [ 3583 ]
  74848. }
  74849. },
  74850. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  74851. "hide_name": 0,
  74852. "type": "SB_DFFR",
  74853. "parameters": {
  74854. },
  74855. "attributes": {
  74856. "module_not_derived": "00000000000000000000000000000001",
  74857. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  74858. },
  74859. "port_directions": {
  74860. "C": "input",
  74861. "D": "input",
  74862. "Q": "output",
  74863. "R": "input"
  74864. },
  74865. "connections": {
  74866. "C": [ 42 ],
  74867. "D": [ 3118 ],
  74868. "Q": [ 3588 ],
  74869. "R": [ 127 ]
  74870. }
  74871. },
  74872. "cpu_I._zz_50__SB_LUT4_O_5": {
  74873. "hide_name": 0,
  74874. "type": "SB_LUT4",
  74875. "parameters": {
  74876. "LUT_INIT": "1111111111110000"
  74877. },
  74878. "attributes": {
  74879. "module_not_derived": "00000000000000000000000000000001",
  74880. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  74881. },
  74882. "port_directions": {
  74883. "I0": "input",
  74884. "I1": "input",
  74885. "I2": "input",
  74886. "I3": "input",
  74887. "O": "output"
  74888. },
  74889. "connections": {
  74890. "I0": [ "0" ],
  74891. "I1": [ "0" ],
  74892. "I2": [ 3589 ],
  74893. "I3": [ 3590 ],
  74894. "O": [ 2272 ]
  74895. }
  74896. },
  74897. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O": {
  74898. "hide_name": 0,
  74899. "type": "SB_LUT4",
  74900. "parameters": {
  74901. "LUT_INIT": "1000000011110000"
  74902. },
  74903. "attributes": {
  74904. "module_not_derived": "00000000000000000000000000000001",
  74905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74906. },
  74907. "port_directions": {
  74908. "I0": "input",
  74909. "I1": "input",
  74910. "I2": "input",
  74911. "I3": "input",
  74912. "O": "output"
  74913. },
  74914. "connections": {
  74915. "I0": [ 3458 ],
  74916. "I1": [ 3304 ],
  74917. "I2": [ 3591 ],
  74918. "I3": [ 3306 ],
  74919. "O": [ 3590 ]
  74920. }
  74921. },
  74922. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  74923. "hide_name": 0,
  74924. "type": "SB_LUT4",
  74925. "parameters": {
  74926. "LUT_INIT": "1000110010000000"
  74927. },
  74928. "attributes": {
  74929. "module_not_derived": "00000000000000000000000000000001",
  74930. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74931. },
  74932. "port_directions": {
  74933. "I0": "input",
  74934. "I1": "input",
  74935. "I2": "input",
  74936. "I3": "input",
  74937. "O": "output"
  74938. },
  74939. "connections": {
  74940. "I0": [ 3592 ],
  74941. "I1": [ 3296 ],
  74942. "I2": [ 3308 ],
  74943. "I3": [ 3593 ],
  74944. "O": [ 3589 ]
  74945. }
  74946. },
  74947. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  74948. "hide_name": 0,
  74949. "type": "SB_LUT4",
  74950. "parameters": {
  74951. "LUT_INIT": "0110100110010110"
  74952. },
  74953. "attributes": {
  74954. "module_not_derived": "00000000000000000000000000000001",
  74955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  74956. },
  74957. "port_directions": {
  74958. "I0": "input",
  74959. "I1": "input",
  74960. "I2": "input",
  74961. "I3": "input",
  74962. "O": "output"
  74963. },
  74964. "connections": {
  74965. "I0": [ "0" ],
  74966. "I1": [ 3310 ],
  74967. "I2": [ 3594 ],
  74968. "I3": [ 3595 ],
  74969. "O": [ 3593 ]
  74970. }
  74971. },
  74972. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  74973. "hide_name": 0,
  74974. "type": "SB_CARRY",
  74975. "parameters": {
  74976. },
  74977. "attributes": {
  74978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  74979. },
  74980. "port_directions": {
  74981. "CI": "input",
  74982. "CO": "output",
  74983. "I0": "input",
  74984. "I1": "input"
  74985. },
  74986. "connections": {
  74987. "CI": [ 3587 ],
  74988. "CO": [ 3595 ],
  74989. "I0": [ 3310 ],
  74990. "I1": [ 3586 ]
  74991. }
  74992. },
  74993. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  74994. "hide_name": 0,
  74995. "type": "SB_LUT4",
  74996. "parameters": {
  74997. "LUT_INIT": "0000000011111100"
  74998. },
  74999. "attributes": {
  75000. "module_not_derived": "00000000000000000000000000000001",
  75001. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75002. },
  75003. "port_directions": {
  75004. "I0": "input",
  75005. "I1": "input",
  75006. "I2": "input",
  75007. "I3": "input",
  75008. "O": "output"
  75009. },
  75010. "connections": {
  75011. "I0": [ "0" ],
  75012. "I1": [ 3596 ],
  75013. "I2": [ 3316 ],
  75014. "I3": [ 3296 ],
  75015. "O": [ 3591 ]
  75016. }
  75017. },
  75018. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  75019. "hide_name": 0,
  75020. "type": "SB_DFFR",
  75021. "parameters": {
  75022. },
  75023. "attributes": {
  75024. "module_not_derived": "00000000000000000000000000000001",
  75025. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  75026. },
  75027. "port_directions": {
  75028. "C": "input",
  75029. "D": "input",
  75030. "Q": "output",
  75031. "R": "input"
  75032. },
  75033. "connections": {
  75034. "C": [ 42 ],
  75035. "D": [ 3125 ],
  75036. "Q": [ 3596 ],
  75037. "R": [ 127 ]
  75038. }
  75039. },
  75040. "cpu_I._zz_50__SB_LUT4_O_6": {
  75041. "hide_name": 0,
  75042. "type": "SB_LUT4",
  75043. "parameters": {
  75044. "LUT_INIT": "1111111111110000"
  75045. },
  75046. "attributes": {
  75047. "module_not_derived": "00000000000000000000000000000001",
  75048. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  75049. },
  75050. "port_directions": {
  75051. "I0": "input",
  75052. "I1": "input",
  75053. "I2": "input",
  75054. "I3": "input",
  75055. "O": "output"
  75056. },
  75057. "connections": {
  75058. "I0": [ "0" ],
  75059. "I1": [ "0" ],
  75060. "I2": [ 3597 ],
  75061. "I3": [ 3598 ],
  75062. "O": [ 2271 ]
  75063. }
  75064. },
  75065. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O": {
  75066. "hide_name": 0,
  75067. "type": "SB_LUT4",
  75068. "parameters": {
  75069. "LUT_INIT": "1000000011110000"
  75070. },
  75071. "attributes": {
  75072. "module_not_derived": "00000000000000000000000000000001",
  75073. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75074. },
  75075. "port_directions": {
  75076. "I0": "input",
  75077. "I1": "input",
  75078. "I2": "input",
  75079. "I3": "input",
  75080. "O": "output"
  75081. },
  75082. "connections": {
  75083. "I0": [ 3446 ],
  75084. "I1": [ 3304 ],
  75085. "I2": [ 3599 ],
  75086. "I3": [ 3306 ],
  75087. "O": [ 3598 ]
  75088. }
  75089. },
  75090. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_1": {
  75091. "hide_name": 0,
  75092. "type": "SB_LUT4",
  75093. "parameters": {
  75094. "LUT_INIT": "1000110010000000"
  75095. },
  75096. "attributes": {
  75097. "module_not_derived": "00000000000000000000000000000001",
  75098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75099. },
  75100. "port_directions": {
  75101. "I0": "input",
  75102. "I1": "input",
  75103. "I2": "input",
  75104. "I3": "input",
  75105. "O": "output"
  75106. },
  75107. "connections": {
  75108. "I0": [ 3600 ],
  75109. "I1": [ 3296 ],
  75110. "I2": [ 3308 ],
  75111. "I3": [ 3601 ],
  75112. "O": [ 3597 ]
  75113. }
  75114. },
  75115. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  75116. "hide_name": 0,
  75117. "type": "SB_LUT4",
  75118. "parameters": {
  75119. "LUT_INIT": "0110100110010110"
  75120. },
  75121. "attributes": {
  75122. "module_not_derived": "00000000000000000000000000000001",
  75123. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75124. },
  75125. "port_directions": {
  75126. "I0": "input",
  75127. "I1": "input",
  75128. "I2": "input",
  75129. "I3": "input",
  75130. "O": "output"
  75131. },
  75132. "connections": {
  75133. "I0": [ "0" ],
  75134. "I1": [ 3310 ],
  75135. "I2": [ 3602 ],
  75136. "I3": [ 3603 ],
  75137. "O": [ 3601 ]
  75138. }
  75139. },
  75140. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  75141. "hide_name": 0,
  75142. "type": "SB_CARRY",
  75143. "parameters": {
  75144. },
  75145. "attributes": {
  75146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  75147. },
  75148. "port_directions": {
  75149. "CI": "input",
  75150. "CO": "output",
  75151. "I0": "input",
  75152. "I1": "input"
  75153. },
  75154. "connections": {
  75155. "CI": [ 3595 ],
  75156. "CO": [ 3603 ],
  75157. "I0": [ 3310 ],
  75158. "I1": [ 3594 ]
  75159. }
  75160. },
  75161. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  75162. "hide_name": 0,
  75163. "type": "SB_LUT4",
  75164. "parameters": {
  75165. "LUT_INIT": "0000000011111100"
  75166. },
  75167. "attributes": {
  75168. "module_not_derived": "00000000000000000000000000000001",
  75169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75170. },
  75171. "port_directions": {
  75172. "I0": "input",
  75173. "I1": "input",
  75174. "I2": "input",
  75175. "I3": "input",
  75176. "O": "output"
  75177. },
  75178. "connections": {
  75179. "I0": [ "0" ],
  75180. "I1": [ 3604 ],
  75181. "I2": [ 3316 ],
  75182. "I3": [ 3296 ],
  75183. "O": [ 3599 ]
  75184. }
  75185. },
  75186. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  75187. "hide_name": 0,
  75188. "type": "SB_DFFR",
  75189. "parameters": {
  75190. },
  75191. "attributes": {
  75192. "module_not_derived": "00000000000000000000000000000001",
  75193. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  75194. },
  75195. "port_directions": {
  75196. "C": "input",
  75197. "D": "input",
  75198. "Q": "output",
  75199. "R": "input"
  75200. },
  75201. "connections": {
  75202. "C": [ 42 ],
  75203. "D": [ 3222 ],
  75204. "Q": [ 3604 ],
  75205. "R": [ 127 ]
  75206. }
  75207. },
  75208. "cpu_I._zz_50__SB_LUT4_O_7": {
  75209. "hide_name": 0,
  75210. "type": "SB_LUT4",
  75211. "parameters": {
  75212. "LUT_INIT": "1111111111110000"
  75213. },
  75214. "attributes": {
  75215. "module_not_derived": "00000000000000000000000000000001",
  75216. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  75217. },
  75218. "port_directions": {
  75219. "I0": "input",
  75220. "I1": "input",
  75221. "I2": "input",
  75222. "I3": "input",
  75223. "O": "output"
  75224. },
  75225. "connections": {
  75226. "I0": [ "0" ],
  75227. "I1": [ "0" ],
  75228. "I2": [ 3605 ],
  75229. "I3": [ 3606 ],
  75230. "O": [ 2300 ]
  75231. }
  75232. },
  75233. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O": {
  75234. "hide_name": 0,
  75235. "type": "SB_LUT4",
  75236. "parameters": {
  75237. "LUT_INIT": "1000000011110000"
  75238. },
  75239. "attributes": {
  75240. "module_not_derived": "00000000000000000000000000000001",
  75241. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75242. },
  75243. "port_directions": {
  75244. "I0": "input",
  75245. "I1": "input",
  75246. "I2": "input",
  75247. "I3": "input",
  75248. "O": "output"
  75249. },
  75250. "connections": {
  75251. "I0": [ 3607 ],
  75252. "I1": [ 3304 ],
  75253. "I2": [ 3608 ],
  75254. "I3": [ 3306 ],
  75255. "O": [ 3606 ]
  75256. }
  75257. },
  75258. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_1": {
  75259. "hide_name": 0,
  75260. "type": "SB_LUT4",
  75261. "parameters": {
  75262. "LUT_INIT": "1000110010000000"
  75263. },
  75264. "attributes": {
  75265. "module_not_derived": "00000000000000000000000000000001",
  75266. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75267. },
  75268. "port_directions": {
  75269. "I0": "input",
  75270. "I1": "input",
  75271. "I2": "input",
  75272. "I3": "input",
  75273. "O": "output"
  75274. },
  75275. "connections": {
  75276. "I0": [ 3609 ],
  75277. "I1": [ 3296 ],
  75278. "I2": [ 3308 ],
  75279. "I3": [ 3610 ],
  75280. "O": [ 3605 ]
  75281. }
  75282. },
  75283. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  75284. "hide_name": 0,
  75285. "type": "SB_LUT4",
  75286. "parameters": {
  75287. "LUT_INIT": "0110100110010110"
  75288. },
  75289. "attributes": {
  75290. "module_not_derived": "00000000000000000000000000000001",
  75291. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75292. },
  75293. "port_directions": {
  75294. "I0": "input",
  75295. "I1": "input",
  75296. "I2": "input",
  75297. "I3": "input",
  75298. "O": "output"
  75299. },
  75300. "connections": {
  75301. "I0": [ "0" ],
  75302. "I1": [ 3310 ],
  75303. "I2": [ 3611 ],
  75304. "I3": [ 3612 ],
  75305. "O": [ 3610 ]
  75306. }
  75307. },
  75308. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  75309. "hide_name": 0,
  75310. "type": "SB_CARRY",
  75311. "parameters": {
  75312. },
  75313. "attributes": {
  75314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  75315. },
  75316. "port_directions": {
  75317. "CI": "input",
  75318. "CO": "output",
  75319. "I0": "input",
  75320. "I1": "input"
  75321. },
  75322. "connections": {
  75323. "CI": [ 3603 ],
  75324. "CO": [ 3612 ],
  75325. "I0": [ 3310 ],
  75326. "I1": [ 3602 ]
  75327. }
  75328. },
  75329. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  75330. "hide_name": 0,
  75331. "type": "SB_LUT4",
  75332. "parameters": {
  75333. "LUT_INIT": "0000000011111100"
  75334. },
  75335. "attributes": {
  75336. "module_not_derived": "00000000000000000000000000000001",
  75337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75338. },
  75339. "port_directions": {
  75340. "I0": "input",
  75341. "I1": "input",
  75342. "I2": "input",
  75343. "I3": "input",
  75344. "O": "output"
  75345. },
  75346. "connections": {
  75347. "I0": [ "0" ],
  75348. "I1": [ 3613 ],
  75349. "I2": [ 3316 ],
  75350. "I3": [ 3296 ],
  75351. "O": [ 3608 ]
  75352. }
  75353. },
  75354. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  75355. "hide_name": 0,
  75356. "type": "SB_DFFR",
  75357. "parameters": {
  75358. },
  75359. "attributes": {
  75360. "module_not_derived": "00000000000000000000000000000001",
  75361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  75362. },
  75363. "port_directions": {
  75364. "C": "input",
  75365. "D": "input",
  75366. "Q": "output",
  75367. "R": "input"
  75368. },
  75369. "connections": {
  75370. "C": [ 42 ],
  75371. "D": [ 3132 ],
  75372. "Q": [ 3613 ],
  75373. "R": [ 127 ]
  75374. }
  75375. },
  75376. "cpu_I._zz_50__SB_LUT4_O_8": {
  75377. "hide_name": 0,
  75378. "type": "SB_LUT4",
  75379. "parameters": {
  75380. "LUT_INIT": "1111111111110000"
  75381. },
  75382. "attributes": {
  75383. "module_not_derived": "00000000000000000000000000000001",
  75384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  75385. },
  75386. "port_directions": {
  75387. "I0": "input",
  75388. "I1": "input",
  75389. "I2": "input",
  75390. "I3": "input",
  75391. "O": "output"
  75392. },
  75393. "connections": {
  75394. "I0": [ "0" ],
  75395. "I1": [ "0" ],
  75396. "I2": [ 3614 ],
  75397. "I3": [ 3615 ],
  75398. "O": [ 2299 ]
  75399. }
  75400. },
  75401. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O": {
  75402. "hide_name": 0,
  75403. "type": "SB_LUT4",
  75404. "parameters": {
  75405. "LUT_INIT": "1000000011110000"
  75406. },
  75407. "attributes": {
  75408. "module_not_derived": "00000000000000000000000000000001",
  75409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75410. },
  75411. "port_directions": {
  75412. "I0": "input",
  75413. "I1": "input",
  75414. "I2": "input",
  75415. "I3": "input",
  75416. "O": "output"
  75417. },
  75418. "connections": {
  75419. "I0": [ 3616 ],
  75420. "I1": [ 3304 ],
  75421. "I2": [ 3617 ],
  75422. "I3": [ 3306 ],
  75423. "O": [ 3615 ]
  75424. }
  75425. },
  75426. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_1": {
  75427. "hide_name": 0,
  75428. "type": "SB_LUT4",
  75429. "parameters": {
  75430. "LUT_INIT": "1000110010000000"
  75431. },
  75432. "attributes": {
  75433. "module_not_derived": "00000000000000000000000000000001",
  75434. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75435. },
  75436. "port_directions": {
  75437. "I0": "input",
  75438. "I1": "input",
  75439. "I2": "input",
  75440. "I3": "input",
  75441. "O": "output"
  75442. },
  75443. "connections": {
  75444. "I0": [ 3618 ],
  75445. "I1": [ 3296 ],
  75446. "I2": [ 3308 ],
  75447. "I3": [ 3619 ],
  75448. "O": [ 3614 ]
  75449. }
  75450. },
  75451. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  75452. "hide_name": 0,
  75453. "type": "SB_LUT4",
  75454. "parameters": {
  75455. "LUT_INIT": "0110100110010110"
  75456. },
  75457. "attributes": {
  75458. "module_not_derived": "00000000000000000000000000000001",
  75459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75460. },
  75461. "port_directions": {
  75462. "I0": "input",
  75463. "I1": "input",
  75464. "I2": "input",
  75465. "I3": "input",
  75466. "O": "output"
  75467. },
  75468. "connections": {
  75469. "I0": [ "0" ],
  75470. "I1": [ 3310 ],
  75471. "I2": [ 3620 ],
  75472. "I3": [ 3621 ],
  75473. "O": [ 3619 ]
  75474. }
  75475. },
  75476. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  75477. "hide_name": 0,
  75478. "type": "SB_CARRY",
  75479. "parameters": {
  75480. },
  75481. "attributes": {
  75482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  75483. },
  75484. "port_directions": {
  75485. "CI": "input",
  75486. "CO": "output",
  75487. "I0": "input",
  75488. "I1": "input"
  75489. },
  75490. "connections": {
  75491. "CI": [ 3612 ],
  75492. "CO": [ 3621 ],
  75493. "I0": [ 3310 ],
  75494. "I1": [ 3611 ]
  75495. }
  75496. },
  75497. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  75498. "hide_name": 0,
  75499. "type": "SB_LUT4",
  75500. "parameters": {
  75501. "LUT_INIT": "0000000011111100"
  75502. },
  75503. "attributes": {
  75504. "module_not_derived": "00000000000000000000000000000001",
  75505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75506. },
  75507. "port_directions": {
  75508. "I0": "input",
  75509. "I1": "input",
  75510. "I2": "input",
  75511. "I3": "input",
  75512. "O": "output"
  75513. },
  75514. "connections": {
  75515. "I0": [ "0" ],
  75516. "I1": [ 3622 ],
  75517. "I2": [ 3316 ],
  75518. "I3": [ 3296 ],
  75519. "O": [ 3617 ]
  75520. }
  75521. },
  75522. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  75523. "hide_name": 0,
  75524. "type": "SB_DFFR",
  75525. "parameters": {
  75526. },
  75527. "attributes": {
  75528. "module_not_derived": "00000000000000000000000000000001",
  75529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  75530. },
  75531. "port_directions": {
  75532. "C": "input",
  75533. "D": "input",
  75534. "Q": "output",
  75535. "R": "input"
  75536. },
  75537. "connections": {
  75538. "C": [ 42 ],
  75539. "D": [ 3215 ],
  75540. "Q": [ 3622 ],
  75541. "R": [ 127 ]
  75542. }
  75543. },
  75544. "cpu_I._zz_50__SB_LUT4_O_9": {
  75545. "hide_name": 0,
  75546. "type": "SB_LUT4",
  75547. "parameters": {
  75548. "LUT_INIT": "1111111111110000"
  75549. },
  75550. "attributes": {
  75551. "module_not_derived": "00000000000000000000000000000001",
  75552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  75553. },
  75554. "port_directions": {
  75555. "I0": "input",
  75556. "I1": "input",
  75557. "I2": "input",
  75558. "I3": "input",
  75559. "O": "output"
  75560. },
  75561. "connections": {
  75562. "I0": [ "0" ],
  75563. "I1": [ "0" ],
  75564. "I2": [ 3623 ],
  75565. "I3": [ 3624 ],
  75566. "O": [ 2298 ]
  75567. }
  75568. },
  75569. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O": {
  75570. "hide_name": 0,
  75571. "type": "SB_LUT4",
  75572. "parameters": {
  75573. "LUT_INIT": "1000000011110000"
  75574. },
  75575. "attributes": {
  75576. "module_not_derived": "00000000000000000000000000000001",
  75577. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75578. },
  75579. "port_directions": {
  75580. "I0": "input",
  75581. "I1": "input",
  75582. "I2": "input",
  75583. "I3": "input",
  75584. "O": "output"
  75585. },
  75586. "connections": {
  75587. "I0": [ 3397 ],
  75588. "I1": [ 3304 ],
  75589. "I2": [ 3625 ],
  75590. "I3": [ 3306 ],
  75591. "O": [ 3624 ]
  75592. }
  75593. },
  75594. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_1": {
  75595. "hide_name": 0,
  75596. "type": "SB_LUT4",
  75597. "parameters": {
  75598. "LUT_INIT": "1000110010000000"
  75599. },
  75600. "attributes": {
  75601. "module_not_derived": "00000000000000000000000000000001",
  75602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75603. },
  75604. "port_directions": {
  75605. "I0": "input",
  75606. "I1": "input",
  75607. "I2": "input",
  75608. "I3": "input",
  75609. "O": "output"
  75610. },
  75611. "connections": {
  75612. "I0": [ 3626 ],
  75613. "I1": [ 3296 ],
  75614. "I2": [ 3308 ],
  75615. "I3": [ 3627 ],
  75616. "O": [ 3623 ]
  75617. }
  75618. },
  75619. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  75620. "hide_name": 0,
  75621. "type": "SB_LUT4",
  75622. "parameters": {
  75623. "LUT_INIT": "0110100110010110"
  75624. },
  75625. "attributes": {
  75626. "module_not_derived": "00000000000000000000000000000001",
  75627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75628. },
  75629. "port_directions": {
  75630. "I0": "input",
  75631. "I1": "input",
  75632. "I2": "input",
  75633. "I3": "input",
  75634. "O": "output"
  75635. },
  75636. "connections": {
  75637. "I0": [ "0" ],
  75638. "I1": [ 3310 ],
  75639. "I2": [ 3314 ],
  75640. "I3": [ 3313 ],
  75641. "O": [ 3627 ]
  75642. }
  75643. },
  75644. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  75645. "hide_name": 0,
  75646. "type": "SB_CARRY",
  75647. "parameters": {
  75648. },
  75649. "attributes": {
  75650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  75651. },
  75652. "port_directions": {
  75653. "CI": "input",
  75654. "CO": "output",
  75655. "I0": "input",
  75656. "I1": "input"
  75657. },
  75658. "connections": {
  75659. "CI": [ 3621 ],
  75660. "CO": [ 3313 ],
  75661. "I0": [ 3310 ],
  75662. "I1": [ 3620 ]
  75663. }
  75664. },
  75665. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  75666. "hide_name": 0,
  75667. "type": "SB_LUT4",
  75668. "parameters": {
  75669. "LUT_INIT": "0000000011111100"
  75670. },
  75671. "attributes": {
  75672. "module_not_derived": "00000000000000000000000000000001",
  75673. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75674. },
  75675. "port_directions": {
  75676. "I0": "input",
  75677. "I1": "input",
  75678. "I2": "input",
  75679. "I3": "input",
  75680. "O": "output"
  75681. },
  75682. "connections": {
  75683. "I0": [ "0" ],
  75684. "I1": [ 3628 ],
  75685. "I2": [ 3316 ],
  75686. "I3": [ 3296 ],
  75687. "O": [ 3625 ]
  75688. }
  75689. },
  75690. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  75691. "hide_name": 0,
  75692. "type": "SB_DFFR",
  75693. "parameters": {
  75694. },
  75695. "attributes": {
  75696. "module_not_derived": "00000000000000000000000000000001",
  75697. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  75698. },
  75699. "port_directions": {
  75700. "C": "input",
  75701. "D": "input",
  75702. "Q": "output",
  75703. "R": "input"
  75704. },
  75705. "connections": {
  75706. "C": [ 42 ],
  75707. "D": [ 3139 ],
  75708. "Q": [ 3628 ],
  75709. "R": [ 127 ]
  75710. }
  75711. },
  75712. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O": {
  75713. "hide_name": 0,
  75714. "type": "SB_LUT4",
  75715. "parameters": {
  75716. "LUT_INIT": "1111001100000011"
  75717. },
  75718. "attributes": {
  75719. "module_not_derived": "00000000000000000000000000000001",
  75720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75721. },
  75722. "port_directions": {
  75723. "I0": "input",
  75724. "I1": "input",
  75725. "I2": "input",
  75726. "I3": "input",
  75727. "O": "output"
  75728. },
  75729. "connections": {
  75730. "I0": [ "0" ],
  75731. "I1": [ 3629 ],
  75732. "I2": [ 3316 ],
  75733. "I3": [ 3630 ],
  75734. "O": [ 3298 ]
  75735. }
  75736. },
  75737. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_1": {
  75738. "hide_name": 0,
  75739. "type": "SB_LUT4",
  75740. "parameters": {
  75741. "LUT_INIT": "0011001100001111"
  75742. },
  75743. "attributes": {
  75744. "module_not_derived": "00000000000000000000000000000001",
  75745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75746. },
  75747. "port_directions": {
  75748. "I0": "input",
  75749. "I1": "input",
  75750. "I2": "input",
  75751. "I3": "input",
  75752. "O": "output"
  75753. },
  75754. "connections": {
  75755. "I0": [ "0" ],
  75756. "I1": [ 3631 ],
  75757. "I2": [ 3632 ],
  75758. "I3": [ 3308 ],
  75759. "O": [ 3297 ]
  75760. }
  75761. },
  75762. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  75763. "hide_name": 0,
  75764. "type": "SB_LUT4",
  75765. "parameters": {
  75766. "LUT_INIT": "0110100110010110"
  75767. },
  75768. "attributes": {
  75769. "module_not_derived": "00000000000000000000000000000001",
  75770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75771. },
  75772. "port_directions": {
  75773. "I0": "input",
  75774. "I1": "input",
  75775. "I2": "input",
  75776. "I3": "input",
  75777. "O": "output"
  75778. },
  75779. "connections": {
  75780. "I0": [ "0" ],
  75781. "I1": [ 3411 ],
  75782. "I2": [ 3412 ],
  75783. "I3": [ 3410 ],
  75784. "O": [ 3632 ]
  75785. }
  75786. },
  75787. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  75788. "hide_name": 0,
  75789. "type": "SB_CARRY",
  75790. "parameters": {
  75791. },
  75792. "attributes": {
  75793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  75794. },
  75795. "port_directions": {
  75796. "CI": "input",
  75797. "CO": "output",
  75798. "I0": "input",
  75799. "I1": "input"
  75800. },
  75801. "connections": {
  75802. "CI": [ 3437 ],
  75803. "CO": [ 3410 ],
  75804. "I0": [ 3435 ],
  75805. "I1": [ 3436 ]
  75806. }
  75807. },
  75808. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_DFFR_Q": {
  75809. "hide_name": 0,
  75810. "type": "SB_DFFR",
  75811. "parameters": {
  75812. },
  75813. "attributes": {
  75814. "module_not_derived": "00000000000000000000000000000001",
  75815. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  75816. },
  75817. "port_directions": {
  75818. "C": "input",
  75819. "D": "input",
  75820. "Q": "output",
  75821. "R": "input"
  75822. },
  75823. "connections": {
  75824. "C": [ 42 ],
  75825. "D": [ 3231 ],
  75826. "Q": [ 3629 ],
  75827. "R": [ 127 ]
  75828. }
  75829. },
  75830. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  75831. "hide_name": 0,
  75832. "type": "SB_LUT4",
  75833. "parameters": {
  75834. "LUT_INIT": "0011111100000000"
  75835. },
  75836. "attributes": {
  75837. "module_not_derived": "00000000000000000000000000000001",
  75838. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75839. },
  75840. "port_directions": {
  75841. "I0": "input",
  75842. "I1": "input",
  75843. "I2": "input",
  75844. "I3": "input",
  75845. "O": "output"
  75846. },
  75847. "connections": {
  75848. "I0": [ "0" ],
  75849. "I1": [ 3633 ],
  75850. "I2": [ 3442 ],
  75851. "I3": [ 3634 ],
  75852. "O": [ 3630 ]
  75853. }
  75854. },
  75855. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_I2": {
  75856. "hide_name": 0,
  75857. "type": "SB_LUT4",
  75858. "parameters": {
  75859. "LUT_INIT": "0011111100000000"
  75860. },
  75861. "attributes": {
  75862. "module_not_derived": "00000000000000000000000000000001",
  75863. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  75864. },
  75865. "port_directions": {
  75866. "I0": "input",
  75867. "I1": "input",
  75868. "I2": "input",
  75869. "I3": "input",
  75870. "O": "output"
  75871. },
  75872. "connections": {
  75873. "I0": [ "0" ],
  75874. "I1": [ 3635 ],
  75875. "I2": [ 3442 ],
  75876. "I3": [ 3636 ],
  75877. "O": [ 3404 ]
  75878. }
  75879. },
  75880. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_I2_O_SB_LUT4_O": {
  75881. "hide_name": 0,
  75882. "type": "SB_LUT4",
  75883. "parameters": {
  75884. "LUT_INIT": "0000000000001111"
  75885. },
  75886. "attributes": {
  75887. "module_not_derived": "00000000000000000000000000000001",
  75888. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  75889. },
  75890. "port_directions": {
  75891. "I0": "input",
  75892. "I1": "input",
  75893. "I2": "input",
  75894. "I3": "input",
  75895. "O": "output"
  75896. },
  75897. "connections": {
  75898. "I0": [ "0" ],
  75899. "I1": [ "0" ],
  75900. "I2": [ 3304 ],
  75901. "I3": [ 3402 ],
  75902. "O": [ 3308 ]
  75903. }
  75904. },
  75905. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  75906. "hide_name": 0,
  75907. "type": "SB_LUT4",
  75908. "parameters": {
  75909. "LUT_INIT": "0000000000001111"
  75910. },
  75911. "attributes": {
  75912. "module_not_derived": "00000000000000000000000000000001",
  75913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  75914. },
  75915. "port_directions": {
  75916. "I0": "input",
  75917. "I1": "input",
  75918. "I2": "input",
  75919. "I3": "input",
  75920. "O": "output"
  75921. },
  75922. "connections": {
  75923. "I0": [ "0" ],
  75924. "I1": [ "0" ],
  75925. "I2": [ 3385 ],
  75926. "I3": [ 3386 ],
  75927. "O": [ 3442 ]
  75928. }
  75929. },
  75930. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_O_1": {
  75931. "hide_name": 0,
  75932. "type": "SB_LUT4",
  75933. "parameters": {
  75934. "LUT_INIT": "1111011100000000"
  75935. },
  75936. "attributes": {
  75937. "module_not_derived": "00000000000000000000000000000001",
  75938. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75939. },
  75940. "port_directions": {
  75941. "I0": "input",
  75942. "I1": "input",
  75943. "I2": "input",
  75944. "I3": "input",
  75945. "O": "output"
  75946. },
  75947. "connections": {
  75948. "I0": [ 3616 ],
  75949. "I1": [ 3385 ],
  75950. "I2": [ 3386 ],
  75951. "I3": [ 3637 ],
  75952. "O": [ 3636 ]
  75953. }
  75954. },
  75955. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  75956. "hide_name": 0,
  75957. "type": "SB_LUT4",
  75958. "parameters": {
  75959. "LUT_INIT": "0101001111111111"
  75960. },
  75961. "attributes": {
  75962. "module_not_derived": "00000000000000000000000000000001",
  75963. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75964. },
  75965. "port_directions": {
  75966. "I0": "input",
  75967. "I1": "input",
  75968. "I2": "input",
  75969. "I3": "input",
  75970. "O": "output"
  75971. },
  75972. "connections": {
  75973. "I0": [ 3363 ],
  75974. "I1": [ 3425 ],
  75975. "I2": [ 3385 ],
  75976. "I3": [ 3386 ],
  75977. "O": [ 3637 ]
  75978. }
  75979. },
  75980. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  75981. "hide_name": 0,
  75982. "type": "SB_LUT4",
  75983. "parameters": {
  75984. "LUT_INIT": "1101111100000000"
  75985. },
  75986. "attributes": {
  75987. "module_not_derived": "00000000000000000000000000000001",
  75988. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  75989. },
  75990. "port_directions": {
  75991. "I0": "input",
  75992. "I1": "input",
  75993. "I2": "input",
  75994. "I3": "input",
  75995. "O": "output"
  75996. },
  75997. "connections": {
  75998. "I0": [ 3518 ],
  75999. "I1": [ 3385 ],
  76000. "I2": [ 3386 ],
  76001. "I3": [ 3638 ],
  76002. "O": [ 3634 ]
  76003. }
  76004. },
  76005. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  76006. "hide_name": 0,
  76007. "type": "SB_LUT4",
  76008. "parameters": {
  76009. "LUT_INIT": "0101111100111111"
  76010. },
  76011. "attributes": {
  76012. "module_not_derived": "00000000000000000000000000000001",
  76013. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76014. },
  76015. "port_directions": {
  76016. "I0": "input",
  76017. "I1": "input",
  76018. "I2": "input",
  76019. "I3": "input",
  76020. "O": "output"
  76021. },
  76022. "connections": {
  76023. "I0": [ 3354 ],
  76024. "I1": [ 3607 ],
  76025. "I2": [ 3385 ],
  76026. "I3": [ 3386 ],
  76027. "O": [ 3638 ]
  76028. }
  76029. },
  76030. "cpu_I._zz_75__SB_LUT4_O": {
  76031. "hide_name": 0,
  76032. "type": "SB_LUT4",
  76033. "parameters": {
  76034. "LUT_INIT": "1100110011110000"
  76035. },
  76036. "attributes": {
  76037. "module_not_derived": "00000000000000000000000000000001",
  76038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76039. },
  76040. "port_directions": {
  76041. "I0": "input",
  76042. "I1": "input",
  76043. "I2": "input",
  76044. "I3": "input",
  76045. "O": "output"
  76046. },
  76047. "connections": {
  76048. "I0": [ "0" ],
  76049. "I1": [ 1552 ],
  76050. "I2": [ 1542 ],
  76051. "I3": [ 1994 ],
  76052. "O": [ 1824 ]
  76053. }
  76054. },
  76055. "cpu_I._zz_82__SB_LUT4_O": {
  76056. "hide_name": 0,
  76057. "type": "SB_LUT4",
  76058. "parameters": {
  76059. "LUT_INIT": "1111000111100000"
  76060. },
  76061. "attributes": {
  76062. "module_not_derived": "00000000000000000000000000000001",
  76063. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76064. },
  76065. "port_directions": {
  76066. "I0": "input",
  76067. "I1": "input",
  76068. "I2": "input",
  76069. "I3": "input",
  76070. "O": "output"
  76071. },
  76072. "connections": {
  76073. "I0": [ 964 ],
  76074. "I1": [ 966 ],
  76075. "I2": [ 3061 ],
  76076. "I3": [ 3639 ],
  76077. "O": [ 3640 ]
  76078. }
  76079. },
  76080. "cpu_I._zz_82__SB_LUT4_O_1": {
  76081. "hide_name": 0,
  76082. "type": "SB_LUT4",
  76083. "parameters": {
  76084. "LUT_INIT": "1111000111100000"
  76085. },
  76086. "attributes": {
  76087. "module_not_derived": "00000000000000000000000000000001",
  76088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76089. },
  76090. "port_directions": {
  76091. "I0": "input",
  76092. "I1": "input",
  76093. "I2": "input",
  76094. "I3": "input",
  76095. "O": "output"
  76096. },
  76097. "connections": {
  76098. "I0": [ 964 ],
  76099. "I1": [ 966 ],
  76100. "I2": [ 3641 ],
  76101. "I3": [ 2535 ],
  76102. "O": [ 3642 ]
  76103. }
  76104. },
  76105. "cpu_I._zz_82__SB_LUT4_O_10": {
  76106. "hide_name": 0,
  76107. "type": "SB_LUT4",
  76108. "parameters": {
  76109. "LUT_INIT": "1100000011111111"
  76110. },
  76111. "attributes": {
  76112. "module_not_derived": "00000000000000000000000000000001",
  76113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76114. },
  76115. "port_directions": {
  76116. "I0": "input",
  76117. "I1": "input",
  76118. "I2": "input",
  76119. "I3": "input",
  76120. "O": "output"
  76121. },
  76122. "connections": {
  76123. "I0": [ "0" ],
  76124. "I1": [ 3643 ],
  76125. "I2": [ 964 ],
  76126. "I3": [ 3644 ],
  76127. "O": [ 3645 ]
  76128. }
  76129. },
  76130. "cpu_I._zz_82__SB_LUT4_O_10_I3_SB_LUT4_O": {
  76131. "hide_name": 0,
  76132. "type": "SB_LUT4",
  76133. "parameters": {
  76134. "LUT_INIT": "1010111010111111"
  76135. },
  76136. "attributes": {
  76137. "module_not_derived": "00000000000000000000000000000001",
  76138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76139. },
  76140. "port_directions": {
  76141. "I0": "input",
  76142. "I1": "input",
  76143. "I2": "input",
  76144. "I3": "input",
  76145. "O": "output"
  76146. },
  76147. "connections": {
  76148. "I0": [ 964 ],
  76149. "I1": [ 966 ],
  76150. "I2": [ 3076 ],
  76151. "I3": [ 3646 ],
  76152. "O": [ 3644 ]
  76153. }
  76154. },
  76155. "cpu_I._zz_82__SB_LUT4_O_11": {
  76156. "hide_name": 0,
  76157. "type": "SB_LUT4",
  76158. "parameters": {
  76159. "LUT_INIT": "1100000011111111"
  76160. },
  76161. "attributes": {
  76162. "module_not_derived": "00000000000000000000000000000001",
  76163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76164. },
  76165. "port_directions": {
  76166. "I0": "input",
  76167. "I1": "input",
  76168. "I2": "input",
  76169. "I3": "input",
  76170. "O": "output"
  76171. },
  76172. "connections": {
  76173. "I0": [ "0" ],
  76174. "I1": [ 3647 ],
  76175. "I2": [ 964 ],
  76176. "I3": [ 3648 ],
  76177. "O": [ 3649 ]
  76178. }
  76179. },
  76180. "cpu_I._zz_82__SB_LUT4_O_11_I3_SB_LUT4_O": {
  76181. "hide_name": 0,
  76182. "type": "SB_LUT4",
  76183. "parameters": {
  76184. "LUT_INIT": "1010111010111111"
  76185. },
  76186. "attributes": {
  76187. "module_not_derived": "00000000000000000000000000000001",
  76188. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76189. },
  76190. "port_directions": {
  76191. "I0": "input",
  76192. "I1": "input",
  76193. "I2": "input",
  76194. "I3": "input",
  76195. "O": "output"
  76196. },
  76197. "connections": {
  76198. "I0": [ 964 ],
  76199. "I1": [ 966 ],
  76200. "I2": [ 2870 ],
  76201. "I3": [ 3650 ],
  76202. "O": [ 3648 ]
  76203. }
  76204. },
  76205. "cpu_I._zz_82__SB_LUT4_O_12": {
  76206. "hide_name": 0,
  76207. "type": "SB_LUT4",
  76208. "parameters": {
  76209. "LUT_INIT": "1100000011111111"
  76210. },
  76211. "attributes": {
  76212. "module_not_derived": "00000000000000000000000000000001",
  76213. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76214. },
  76215. "port_directions": {
  76216. "I0": "input",
  76217. "I1": "input",
  76218. "I2": "input",
  76219. "I3": "input",
  76220. "O": "output"
  76221. },
  76222. "connections": {
  76223. "I0": [ "0" ],
  76224. "I1": [ 2996 ],
  76225. "I2": [ 964 ],
  76226. "I3": [ 3651 ],
  76227. "O": [ 3652 ]
  76228. }
  76229. },
  76230. "cpu_I._zz_82__SB_LUT4_O_12_I3_SB_LUT4_O": {
  76231. "hide_name": 0,
  76232. "type": "SB_LUT4",
  76233. "parameters": {
  76234. "LUT_INIT": "1011101010111111"
  76235. },
  76236. "attributes": {
  76237. "module_not_derived": "00000000000000000000000000000001",
  76238. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76239. },
  76240. "port_directions": {
  76241. "I0": "input",
  76242. "I1": "input",
  76243. "I2": "input",
  76244. "I3": "input",
  76245. "O": "output"
  76246. },
  76247. "connections": {
  76248. "I0": [ 964 ],
  76249. "I1": [ 2882 ],
  76250. "I2": [ 966 ],
  76251. "I3": [ 3653 ],
  76252. "O": [ 3651 ]
  76253. }
  76254. },
  76255. "cpu_I._zz_82__SB_LUT4_O_13": {
  76256. "hide_name": 0,
  76257. "type": "SB_LUT4",
  76258. "parameters": {
  76259. "LUT_INIT": "1100000011111111"
  76260. },
  76261. "attributes": {
  76262. "module_not_derived": "00000000000000000000000000000001",
  76263. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76264. },
  76265. "port_directions": {
  76266. "I0": "input",
  76267. "I1": "input",
  76268. "I2": "input",
  76269. "I3": "input",
  76270. "O": "output"
  76271. },
  76272. "connections": {
  76273. "I0": [ "0" ],
  76274. "I1": [ 3654 ],
  76275. "I2": [ 964 ],
  76276. "I3": [ 3655 ],
  76277. "O": [ 3656 ]
  76278. }
  76279. },
  76280. "cpu_I._zz_82__SB_LUT4_O_13_I3_SB_LUT4_O": {
  76281. "hide_name": 0,
  76282. "type": "SB_LUT4",
  76283. "parameters": {
  76284. "LUT_INIT": "1101110011011111"
  76285. },
  76286. "attributes": {
  76287. "module_not_derived": "00000000000000000000000000000001",
  76288. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76289. },
  76290. "port_directions": {
  76291. "I0": "input",
  76292. "I1": "input",
  76293. "I2": "input",
  76294. "I3": "input",
  76295. "O": "output"
  76296. },
  76297. "connections": {
  76298. "I0": [ 3657 ],
  76299. "I1": [ 964 ],
  76300. "I2": [ 966 ],
  76301. "I3": [ 3022 ],
  76302. "O": [ 3655 ]
  76303. }
  76304. },
  76305. "cpu_I._zz_82__SB_LUT4_O_14": {
  76306. "hide_name": 0,
  76307. "type": "SB_LUT4",
  76308. "parameters": {
  76309. "LUT_INIT": "1100000011111111"
  76310. },
  76311. "attributes": {
  76312. "module_not_derived": "00000000000000000000000000000001",
  76313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76314. },
  76315. "port_directions": {
  76316. "I0": "input",
  76317. "I1": "input",
  76318. "I2": "input",
  76319. "I3": "input",
  76320. "O": "output"
  76321. },
  76322. "connections": {
  76323. "I0": [ "0" ],
  76324. "I1": [ 3658 ],
  76325. "I2": [ 964 ],
  76326. "I3": [ 3659 ],
  76327. "O": [ 3660 ]
  76328. }
  76329. },
  76330. "cpu_I._zz_82__SB_LUT4_O_14_I3_SB_LUT4_O": {
  76331. "hide_name": 0,
  76332. "type": "SB_LUT4",
  76333. "parameters": {
  76334. "LUT_INIT": "1101110011011111"
  76335. },
  76336. "attributes": {
  76337. "module_not_derived": "00000000000000000000000000000001",
  76338. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76339. },
  76340. "port_directions": {
  76341. "I0": "input",
  76342. "I1": "input",
  76343. "I2": "input",
  76344. "I3": "input",
  76345. "O": "output"
  76346. },
  76347. "connections": {
  76348. "I0": [ 2898 ],
  76349. "I1": [ 964 ],
  76350. "I2": [ 966 ],
  76351. "I3": [ 3036 ],
  76352. "O": [ 3659 ]
  76353. }
  76354. },
  76355. "cpu_I._zz_82__SB_LUT4_O_15": {
  76356. "hide_name": 0,
  76357. "type": "SB_LUT4",
  76358. "parameters": {
  76359. "LUT_INIT": "1100000011111111"
  76360. },
  76361. "attributes": {
  76362. "module_not_derived": "00000000000000000000000000000001",
  76363. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76364. },
  76365. "port_directions": {
  76366. "I0": "input",
  76367. "I1": "input",
  76368. "I2": "input",
  76369. "I3": "input",
  76370. "O": "output"
  76371. },
  76372. "connections": {
  76373. "I0": [ "0" ],
  76374. "I1": [ 3661 ],
  76375. "I2": [ 964 ],
  76376. "I3": [ 3662 ],
  76377. "O": [ 3663 ]
  76378. }
  76379. },
  76380. "cpu_I._zz_82__SB_LUT4_O_15_I3_SB_LUT4_O": {
  76381. "hide_name": 0,
  76382. "type": "SB_LUT4",
  76383. "parameters": {
  76384. "LUT_INIT": "1101110011011111"
  76385. },
  76386. "attributes": {
  76387. "module_not_derived": "00000000000000000000000000000001",
  76388. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76389. },
  76390. "port_directions": {
  76391. "I0": "input",
  76392. "I1": "input",
  76393. "I2": "input",
  76394. "I3": "input",
  76395. "O": "output"
  76396. },
  76397. "connections": {
  76398. "I0": [ 3664 ],
  76399. "I1": [ 964 ],
  76400. "I2": [ 966 ],
  76401. "I3": [ 3047 ],
  76402. "O": [ 3662 ]
  76403. }
  76404. },
  76405. "cpu_I._zz_82__SB_LUT4_O_16": {
  76406. "hide_name": 0,
  76407. "type": "SB_LUT4",
  76408. "parameters": {
  76409. "LUT_INIT": "1100111111000000"
  76410. },
  76411. "attributes": {
  76412. "module_not_derived": "00000000000000000000000000000001",
  76413. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76414. },
  76415. "port_directions": {
  76416. "I0": "input",
  76417. "I1": "input",
  76418. "I2": "input",
  76419. "I3": "input",
  76420. "O": "output"
  76421. },
  76422. "connections": {
  76423. "I0": [ "0" ],
  76424. "I1": [ 2954 ],
  76425. "I2": [ 964 ],
  76426. "I3": [ 3047 ],
  76427. "O": [ 3665 ]
  76428. }
  76429. },
  76430. "cpu_I._zz_82__SB_LUT4_O_17": {
  76431. "hide_name": 0,
  76432. "type": "SB_LUT4",
  76433. "parameters": {
  76434. "LUT_INIT": "1100111111000000"
  76435. },
  76436. "attributes": {
  76437. "module_not_derived": "00000000000000000000000000000001",
  76438. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76439. },
  76440. "port_directions": {
  76441. "I0": "input",
  76442. "I1": "input",
  76443. "I2": "input",
  76444. "I3": "input",
  76445. "O": "output"
  76446. },
  76447. "connections": {
  76448. "I0": [ "0" ],
  76449. "I1": [ 3666 ],
  76450. "I2": [ 964 ],
  76451. "I3": [ 3036 ],
  76452. "O": [ 3667 ]
  76453. }
  76454. },
  76455. "cpu_I._zz_82__SB_LUT4_O_18": {
  76456. "hide_name": 0,
  76457. "type": "SB_LUT4",
  76458. "parameters": {
  76459. "LUT_INIT": "1100111111000000"
  76460. },
  76461. "attributes": {
  76462. "module_not_derived": "00000000000000000000000000000001",
  76463. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76464. },
  76465. "port_directions": {
  76466. "I0": "input",
  76467. "I1": "input",
  76468. "I2": "input",
  76469. "I3": "input",
  76470. "O": "output"
  76471. },
  76472. "connections": {
  76473. "I0": [ "0" ],
  76474. "I1": [ 3668 ],
  76475. "I2": [ 964 ],
  76476. "I3": [ 3022 ],
  76477. "O": [ 3669 ]
  76478. }
  76479. },
  76480. "cpu_I._zz_82__SB_LUT4_O_19": {
  76481. "hide_name": 0,
  76482. "type": "SB_LUT4",
  76483. "parameters": {
  76484. "LUT_INIT": "1100111111000000"
  76485. },
  76486. "attributes": {
  76487. "module_not_derived": "00000000000000000000000000000001",
  76488. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76489. },
  76490. "port_directions": {
  76491. "I0": "input",
  76492. "I1": "input",
  76493. "I2": "input",
  76494. "I3": "input",
  76495. "O": "output"
  76496. },
  76497. "connections": {
  76498. "I0": [ "0" ],
  76499. "I1": [ 2934 ],
  76500. "I2": [ 964 ],
  76501. "I3": [ 3653 ],
  76502. "O": [ 3670 ]
  76503. }
  76504. },
  76505. "cpu_I._zz_82__SB_LUT4_O_2": {
  76506. "hide_name": 0,
  76507. "type": "SB_LUT4",
  76508. "parameters": {
  76509. "LUT_INIT": "1111000111100000"
  76510. },
  76511. "attributes": {
  76512. "module_not_derived": "00000000000000000000000000000001",
  76513. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76514. },
  76515. "port_directions": {
  76516. "I0": "input",
  76517. "I1": "input",
  76518. "I2": "input",
  76519. "I3": "input",
  76520. "O": "output"
  76521. },
  76522. "connections": {
  76523. "I0": [ 964 ],
  76524. "I1": [ 966 ],
  76525. "I2": [ 3076 ],
  76526. "I3": [ 3646 ],
  76527. "O": [ 3671 ]
  76528. }
  76529. },
  76530. "cpu_I._zz_82__SB_LUT4_O_20": {
  76531. "hide_name": 0,
  76532. "type": "SB_LUT4",
  76533. "parameters": {
  76534. "LUT_INIT": "1100111111000000"
  76535. },
  76536. "attributes": {
  76537. "module_not_derived": "00000000000000000000000000000001",
  76538. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76539. },
  76540. "port_directions": {
  76541. "I0": "input",
  76542. "I1": "input",
  76543. "I2": "input",
  76544. "I3": "input",
  76545. "O": "output"
  76546. },
  76547. "connections": {
  76548. "I0": [ "0" ],
  76549. "I1": [ 3672 ],
  76550. "I2": [ 964 ],
  76551. "I3": [ 3650 ],
  76552. "O": [ 3673 ]
  76553. }
  76554. },
  76555. "cpu_I._zz_82__SB_LUT4_O_21": {
  76556. "hide_name": 0,
  76557. "type": "SB_LUT4",
  76558. "parameters": {
  76559. "LUT_INIT": "1100111111000000"
  76560. },
  76561. "attributes": {
  76562. "module_not_derived": "00000000000000000000000000000001",
  76563. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76564. },
  76565. "port_directions": {
  76566. "I0": "input",
  76567. "I1": "input",
  76568. "I2": "input",
  76569. "I3": "input",
  76570. "O": "output"
  76571. },
  76572. "connections": {
  76573. "I0": [ "0" ],
  76574. "I1": [ 3674 ],
  76575. "I2": [ 964 ],
  76576. "I3": [ 3646 ],
  76577. "O": [ 3675 ]
  76578. }
  76579. },
  76580. "cpu_I._zz_82__SB_LUT4_O_22": {
  76581. "hide_name": 0,
  76582. "type": "SB_LUT4",
  76583. "parameters": {
  76584. "LUT_INIT": "1100111111000000"
  76585. },
  76586. "attributes": {
  76587. "module_not_derived": "00000000000000000000000000000001",
  76588. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76589. },
  76590. "port_directions": {
  76591. "I0": "input",
  76592. "I1": "input",
  76593. "I2": "input",
  76594. "I3": "input",
  76595. "O": "output"
  76596. },
  76597. "connections": {
  76598. "I0": [ "0" ],
  76599. "I1": [ 3676 ],
  76600. "I2": [ 964 ],
  76601. "I3": [ 2535 ],
  76602. "O": [ 3677 ]
  76603. }
  76604. },
  76605. "cpu_I._zz_82__SB_LUT4_O_23": {
  76606. "hide_name": 0,
  76607. "type": "SB_LUT4",
  76608. "parameters": {
  76609. "LUT_INIT": "1100111111000000"
  76610. },
  76611. "attributes": {
  76612. "module_not_derived": "00000000000000000000000000000001",
  76613. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76614. },
  76615. "port_directions": {
  76616. "I0": "input",
  76617. "I1": "input",
  76618. "I2": "input",
  76619. "I3": "input",
  76620. "O": "output"
  76621. },
  76622. "connections": {
  76623. "I0": [ "0" ],
  76624. "I1": [ 2913 ],
  76625. "I2": [ 964 ],
  76626. "I3": [ 3639 ],
  76627. "O": [ 3678 ]
  76628. }
  76629. },
  76630. "cpu_I._zz_82__SB_LUT4_O_3": {
  76631. "hide_name": 0,
  76632. "type": "SB_LUT4",
  76633. "parameters": {
  76634. "LUT_INIT": "1111000111100000"
  76635. },
  76636. "attributes": {
  76637. "module_not_derived": "00000000000000000000000000000001",
  76638. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76639. },
  76640. "port_directions": {
  76641. "I0": "input",
  76642. "I1": "input",
  76643. "I2": "input",
  76644. "I3": "input",
  76645. "O": "output"
  76646. },
  76647. "connections": {
  76648. "I0": [ 964 ],
  76649. "I1": [ 966 ],
  76650. "I2": [ 2870 ],
  76651. "I3": [ 3650 ],
  76652. "O": [ 3679 ]
  76653. }
  76654. },
  76655. "cpu_I._zz_82__SB_LUT4_O_4": {
  76656. "hide_name": 0,
  76657. "type": "SB_LUT4",
  76658. "parameters": {
  76659. "LUT_INIT": "1100110111001000"
  76660. },
  76661. "attributes": {
  76662. "module_not_derived": "00000000000000000000000000000001",
  76663. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76664. },
  76665. "port_directions": {
  76666. "I0": "input",
  76667. "I1": "input",
  76668. "I2": "input",
  76669. "I3": "input",
  76670. "O": "output"
  76671. },
  76672. "connections": {
  76673. "I0": [ 964 ],
  76674. "I1": [ 2882 ],
  76675. "I2": [ 966 ],
  76676. "I3": [ 3653 ],
  76677. "O": [ 3680 ]
  76678. }
  76679. },
  76680. "cpu_I._zz_82__SB_LUT4_O_5": {
  76681. "hide_name": 0,
  76682. "type": "SB_LUT4",
  76683. "parameters": {
  76684. "LUT_INIT": "1010101110101000"
  76685. },
  76686. "attributes": {
  76687. "module_not_derived": "00000000000000000000000000000001",
  76688. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76689. },
  76690. "port_directions": {
  76691. "I0": "input",
  76692. "I1": "input",
  76693. "I2": "input",
  76694. "I3": "input",
  76695. "O": "output"
  76696. },
  76697. "connections": {
  76698. "I0": [ 3657 ],
  76699. "I1": [ 964 ],
  76700. "I2": [ 966 ],
  76701. "I3": [ 3022 ],
  76702. "O": [ 3681 ]
  76703. }
  76704. },
  76705. "cpu_I._zz_82__SB_LUT4_O_6": {
  76706. "hide_name": 0,
  76707. "type": "SB_LUT4",
  76708. "parameters": {
  76709. "LUT_INIT": "1010101110101000"
  76710. },
  76711. "attributes": {
  76712. "module_not_derived": "00000000000000000000000000000001",
  76713. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76714. },
  76715. "port_directions": {
  76716. "I0": "input",
  76717. "I1": "input",
  76718. "I2": "input",
  76719. "I3": "input",
  76720. "O": "output"
  76721. },
  76722. "connections": {
  76723. "I0": [ 2898 ],
  76724. "I1": [ 964 ],
  76725. "I2": [ 966 ],
  76726. "I3": [ 3036 ],
  76727. "O": [ 3682 ]
  76728. }
  76729. },
  76730. "cpu_I._zz_82__SB_LUT4_O_7": {
  76731. "hide_name": 0,
  76732. "type": "SB_LUT4",
  76733. "parameters": {
  76734. "LUT_INIT": "1010101110101000"
  76735. },
  76736. "attributes": {
  76737. "module_not_derived": "00000000000000000000000000000001",
  76738. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76739. },
  76740. "port_directions": {
  76741. "I0": "input",
  76742. "I1": "input",
  76743. "I2": "input",
  76744. "I3": "input",
  76745. "O": "output"
  76746. },
  76747. "connections": {
  76748. "I0": [ 3664 ],
  76749. "I1": [ 964 ],
  76750. "I2": [ 966 ],
  76751. "I3": [ 3047 ],
  76752. "O": [ 3683 ]
  76753. }
  76754. },
  76755. "cpu_I._zz_82__SB_LUT4_O_8": {
  76756. "hide_name": 0,
  76757. "type": "SB_LUT4",
  76758. "parameters": {
  76759. "LUT_INIT": "1100000011111111"
  76760. },
  76761. "attributes": {
  76762. "module_not_derived": "00000000000000000000000000000001",
  76763. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76764. },
  76765. "port_directions": {
  76766. "I0": "input",
  76767. "I1": "input",
  76768. "I2": "input",
  76769. "I3": "input",
  76770. "O": "output"
  76771. },
  76772. "connections": {
  76773. "I0": [ "0" ],
  76774. "I1": [ 3684 ],
  76775. "I2": [ 964 ],
  76776. "I3": [ 3685 ],
  76777. "O": [ 3686 ]
  76778. }
  76779. },
  76780. "cpu_I._zz_82__SB_LUT4_O_8_I3_SB_LUT4_O": {
  76781. "hide_name": 0,
  76782. "type": "SB_LUT4",
  76783. "parameters": {
  76784. "LUT_INIT": "1010111010111111"
  76785. },
  76786. "attributes": {
  76787. "module_not_derived": "00000000000000000000000000000001",
  76788. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76789. },
  76790. "port_directions": {
  76791. "I0": "input",
  76792. "I1": "input",
  76793. "I2": "input",
  76794. "I3": "input",
  76795. "O": "output"
  76796. },
  76797. "connections": {
  76798. "I0": [ 964 ],
  76799. "I1": [ 966 ],
  76800. "I2": [ 3061 ],
  76801. "I3": [ 3639 ],
  76802. "O": [ 3685 ]
  76803. }
  76804. },
  76805. "cpu_I._zz_82__SB_LUT4_O_9": {
  76806. "hide_name": 0,
  76807. "type": "SB_LUT4",
  76808. "parameters": {
  76809. "LUT_INIT": "1100000011111111"
  76810. },
  76811. "attributes": {
  76812. "module_not_derived": "00000000000000000000000000000001",
  76813. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  76814. },
  76815. "port_directions": {
  76816. "I0": "input",
  76817. "I1": "input",
  76818. "I2": "input",
  76819. "I3": "input",
  76820. "O": "output"
  76821. },
  76822. "connections": {
  76823. "I0": [ "0" ],
  76824. "I1": [ 3016 ],
  76825. "I2": [ 964 ],
  76826. "I3": [ 3687 ],
  76827. "O": [ 3688 ]
  76828. }
  76829. },
  76830. "cpu_I._zz_82__SB_LUT4_O_9_I3_SB_LUT4_O": {
  76831. "hide_name": 0,
  76832. "type": "SB_LUT4",
  76833. "parameters": {
  76834. "LUT_INIT": "1010111010111111"
  76835. },
  76836. "attributes": {
  76837. "module_not_derived": "00000000000000000000000000000001",
  76838. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76839. },
  76840. "port_directions": {
  76841. "I0": "input",
  76842. "I1": "input",
  76843. "I2": "input",
  76844. "I3": "input",
  76845. "O": "output"
  76846. },
  76847. "connections": {
  76848. "I0": [ 964 ],
  76849. "I1": [ 966 ],
  76850. "I2": [ 3641 ],
  76851. "I3": [ 2535 ],
  76852. "O": [ 3687 ]
  76853. }
  76854. },
  76855. "cpu_I._zz_89__SB_DFFE_Q": {
  76856. "hide_name": 0,
  76857. "type": "SB_DFFE",
  76858. "parameters": {
  76859. },
  76860. "attributes": {
  76861. "module_not_derived": "00000000000000000000000000000001",
  76862. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:302.3-331.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  76863. },
  76864. "port_directions": {
  76865. "C": "input",
  76866. "D": "input",
  76867. "E": "input",
  76868. "Q": "output"
  76869. },
  76870. "connections": {
  76871. "C": [ 42 ],
  76872. "D": [ 1262 ],
  76873. "E": [ 1472 ],
  76874. "Q": [ 2328 ]
  76875. }
  76876. },
  76877. "cpu_I._zz_89__SB_LUT4_I3": {
  76878. "hide_name": 0,
  76879. "type": "SB_LUT4",
  76880. "parameters": {
  76881. "LUT_INIT": "1010000110100000"
  76882. },
  76883. "attributes": {
  76884. "module_not_derived": "00000000000000000000000000000001",
  76885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  76886. },
  76887. "port_directions": {
  76888. "I0": "input",
  76889. "I1": "input",
  76890. "I2": "input",
  76891. "I3": "input",
  76892. "O": "output"
  76893. },
  76894. "connections": {
  76895. "I0": [ 1363 ],
  76896. "I1": [ 1543 ],
  76897. "I2": [ 1364 ],
  76898. "I3": [ 2328 ],
  76899. "O": [ 1994 ]
  76900. }
  76901. },
  76902. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q": {
  76903. "hide_name": 0,
  76904. "type": "SB_DFFE",
  76905. "parameters": {
  76906. },
  76907. "attributes": {
  76908. "module_not_derived": "00000000000000000000000000000001",
  76909. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  76910. },
  76911. "port_directions": {
  76912. "C": "input",
  76913. "D": "input",
  76914. "E": "input",
  76915. "Q": "output"
  76916. },
  76917. "connections": {
  76918. "C": [ 42 ],
  76919. "D": [ 1244 ],
  76920. "E": [ 942 ],
  76921. "Q": [ 735 ]
  76922. }
  76923. },
  76924. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_1": {
  76925. "hide_name": 0,
  76926. "type": "SB_DFFE",
  76927. "parameters": {
  76928. },
  76929. "attributes": {
  76930. "module_not_derived": "00000000000000000000000000000001",
  76931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  76932. },
  76933. "port_directions": {
  76934. "C": "input",
  76935. "D": "input",
  76936. "E": "input",
  76937. "Q": "output"
  76938. },
  76939. "connections": {
  76940. "C": [ 42 ],
  76941. "D": [ 3689 ],
  76942. "E": [ 942 ],
  76943. "Q": [ 736 ]
  76944. }
  76945. },
  76946. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_10": {
  76947. "hide_name": 0,
  76948. "type": "SB_DFFE",
  76949. "parameters": {
  76950. },
  76951. "attributes": {
  76952. "module_not_derived": "00000000000000000000000000000001",
  76953. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  76954. },
  76955. "port_directions": {
  76956. "C": "input",
  76957. "D": "input",
  76958. "E": "input",
  76959. "Q": "output"
  76960. },
  76961. "connections": {
  76962. "C": [ 42 ],
  76963. "D": [ 3690 ],
  76964. "E": [ 942 ],
  76965. "Q": [ 722 ]
  76966. }
  76967. },
  76968. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_11": {
  76969. "hide_name": 0,
  76970. "type": "SB_DFFE",
  76971. "parameters": {
  76972. },
  76973. "attributes": {
  76974. "module_not_derived": "00000000000000000000000000000001",
  76975. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  76976. },
  76977. "port_directions": {
  76978. "C": "input",
  76979. "D": "input",
  76980. "E": "input",
  76981. "Q": "output"
  76982. },
  76983. "connections": {
  76984. "C": [ 42 ],
  76985. "D": [ 3691 ],
  76986. "E": [ 942 ],
  76987. "Q": [ 720 ]
  76988. }
  76989. },
  76990. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_12": {
  76991. "hide_name": 0,
  76992. "type": "SB_DFFE",
  76993. "parameters": {
  76994. },
  76995. "attributes": {
  76996. "module_not_derived": "00000000000000000000000000000001",
  76997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  76998. },
  76999. "port_directions": {
  77000. "C": "input",
  77001. "D": "input",
  77002. "E": "input",
  77003. "Q": "output"
  77004. },
  77005. "connections": {
  77006. "C": [ 42 ],
  77007. "D": [ 3692 ],
  77008. "E": [ 942 ],
  77009. "Q": [ 718 ]
  77010. }
  77011. },
  77012. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_13": {
  77013. "hide_name": 0,
  77014. "type": "SB_DFFE",
  77015. "parameters": {
  77016. },
  77017. "attributes": {
  77018. "module_not_derived": "00000000000000000000000000000001",
  77019. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77020. },
  77021. "port_directions": {
  77022. "C": "input",
  77023. "D": "input",
  77024. "E": "input",
  77025. "Q": "output"
  77026. },
  77027. "connections": {
  77028. "C": [ 42 ],
  77029. "D": [ 2908 ],
  77030. "E": [ 942 ],
  77031. "Q": [ 708 ]
  77032. }
  77033. },
  77034. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_14": {
  77035. "hide_name": 0,
  77036. "type": "SB_DFFE",
  77037. "parameters": {
  77038. },
  77039. "attributes": {
  77040. "module_not_derived": "00000000000000000000000000000001",
  77041. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77042. },
  77043. "port_directions": {
  77044. "C": "input",
  77045. "D": "input",
  77046. "E": "input",
  77047. "Q": "output"
  77048. },
  77049. "connections": {
  77050. "C": [ 42 ],
  77051. "D": [ 3693 ],
  77052. "E": [ 942 ],
  77053. "Q": [ 685 ]
  77054. }
  77055. },
  77056. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_15": {
  77057. "hide_name": 0,
  77058. "type": "SB_DFFE",
  77059. "parameters": {
  77060. },
  77061. "attributes": {
  77062. "module_not_derived": "00000000000000000000000000000001",
  77063. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77064. },
  77065. "port_directions": {
  77066. "C": "input",
  77067. "D": "input",
  77068. "E": "input",
  77069. "Q": "output"
  77070. },
  77071. "connections": {
  77072. "C": [ 42 ],
  77073. "D": [ 2892 ],
  77074. "E": [ 942 ],
  77075. "Q": [ 682 ]
  77076. }
  77077. },
  77078. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_16": {
  77079. "hide_name": 0,
  77080. "type": "SB_DFFE",
  77081. "parameters": {
  77082. },
  77083. "attributes": {
  77084. "module_not_derived": "00000000000000000000000000000001",
  77085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77086. },
  77087. "port_directions": {
  77088. "C": "input",
  77089. "D": "input",
  77090. "E": "input",
  77091. "Q": "output"
  77092. },
  77093. "connections": {
  77094. "C": [ 42 ],
  77095. "D": [ 3694 ],
  77096. "E": [ 942 ],
  77097. "Q": [ 710 ]
  77098. }
  77099. },
  77100. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_17": {
  77101. "hide_name": 0,
  77102. "type": "SB_DFFE",
  77103. "parameters": {
  77104. },
  77105. "attributes": {
  77106. "module_not_derived": "00000000000000000000000000000001",
  77107. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77108. },
  77109. "port_directions": {
  77110. "C": "input",
  77111. "D": "input",
  77112. "E": "input",
  77113. "Q": "output"
  77114. },
  77115. "connections": {
  77116. "C": [ 42 ],
  77117. "D": [ 2877 ],
  77118. "E": [ 942 ],
  77119. "Q": [ 712 ]
  77120. }
  77121. },
  77122. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_18": {
  77123. "hide_name": 0,
  77124. "type": "SB_DFFE",
  77125. "parameters": {
  77126. },
  77127. "attributes": {
  77128. "module_not_derived": "00000000000000000000000000000001",
  77129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77130. },
  77131. "port_directions": {
  77132. "C": "input",
  77133. "D": "input",
  77134. "E": "input",
  77135. "Q": "output"
  77136. },
  77137. "connections": {
  77138. "C": [ 42 ],
  77139. "D": [ 2865 ],
  77140. "E": [ 942 ],
  77141. "Q": [ 714 ]
  77142. }
  77143. },
  77144. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_19": {
  77145. "hide_name": 0,
  77146. "type": "SB_DFFE",
  77147. "parameters": {
  77148. },
  77149. "attributes": {
  77150. "module_not_derived": "00000000000000000000000000000001",
  77151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77152. },
  77153. "port_directions": {
  77154. "C": "input",
  77155. "D": "input",
  77156. "E": "input",
  77157. "Q": "output"
  77158. },
  77159. "connections": {
  77160. "C": [ 42 ],
  77161. "D": [ 3071 ],
  77162. "E": [ 942 ],
  77163. "Q": [ 716 ]
  77164. }
  77165. },
  77166. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_2": {
  77167. "hide_name": 0,
  77168. "type": "SB_DFFE",
  77169. "parameters": {
  77170. },
  77171. "attributes": {
  77172. "module_not_derived": "00000000000000000000000000000001",
  77173. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77174. },
  77175. "port_directions": {
  77176. "C": "input",
  77177. "D": "input",
  77178. "E": "input",
  77179. "Q": "output"
  77180. },
  77181. "connections": {
  77182. "C": [ 42 ],
  77183. "D": [ 3695 ],
  77184. "E": [ 942 ],
  77185. "Q": [ 893 ]
  77186. }
  77187. },
  77188. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_20": {
  77189. "hide_name": 0,
  77190. "type": "SB_DFFE",
  77191. "parameters": {
  77192. },
  77193. "attributes": {
  77194. "module_not_derived": "00000000000000000000000000000001",
  77195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77196. },
  77197. "port_directions": {
  77198. "C": "input",
  77199. "D": "input",
  77200. "E": "input",
  77201. "Q": "output"
  77202. },
  77203. "connections": {
  77204. "C": [ 42 ],
  77205. "D": [ 3696 ],
  77206. "E": [ 942 ],
  77207. "Q": [ 691 ]
  77208. }
  77209. },
  77210. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_21": {
  77211. "hide_name": 0,
  77212. "type": "SB_DFFE",
  77213. "parameters": {
  77214. },
  77215. "attributes": {
  77216. "module_not_derived": "00000000000000000000000000000001",
  77217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77218. },
  77219. "port_directions": {
  77220. "C": "input",
  77221. "D": "input",
  77222. "E": "input",
  77223. "Q": "output"
  77224. },
  77225. "connections": {
  77226. "C": [ 42 ],
  77227. "D": [ 3054 ],
  77228. "E": [ 942 ],
  77229. "Q": [ 693 ]
  77230. }
  77231. },
  77232. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_22": {
  77233. "hide_name": 0,
  77234. "type": "SB_DFFE",
  77235. "parameters": {
  77236. },
  77237. "attributes": {
  77238. "module_not_derived": "00000000000000000000000000000001",
  77239. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77240. },
  77241. "port_directions": {
  77242. "C": "input",
  77243. "D": "input",
  77244. "E": "input",
  77245. "Q": "output"
  77246. },
  77247. "connections": {
  77248. "C": [ 42 ],
  77249. "D": [ 3040 ],
  77250. "E": [ 942 ],
  77251. "Q": [ 695 ]
  77252. }
  77253. },
  77254. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_23": {
  77255. "hide_name": 0,
  77256. "type": "SB_DFFE",
  77257. "parameters": {
  77258. },
  77259. "attributes": {
  77260. "module_not_derived": "00000000000000000000000000000001",
  77261. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77262. },
  77263. "port_directions": {
  77264. "C": "input",
  77265. "D": "input",
  77266. "E": "input",
  77267. "Q": "output"
  77268. },
  77269. "connections": {
  77270. "C": [ 42 ],
  77271. "D": [ 3029 ],
  77272. "E": [ 942 ],
  77273. "Q": [ 697 ]
  77274. }
  77275. },
  77276. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_24": {
  77277. "hide_name": 0,
  77278. "type": "SB_DFFE",
  77279. "parameters": {
  77280. },
  77281. "attributes": {
  77282. "module_not_derived": "00000000000000000000000000000001",
  77283. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77284. },
  77285. "port_directions": {
  77286. "C": "input",
  77287. "D": "input",
  77288. "E": "input",
  77289. "Q": "output"
  77290. },
  77291. "connections": {
  77292. "C": [ 42 ],
  77293. "D": [ 3007 ],
  77294. "E": [ 942 ],
  77295. "Q": [ 699 ]
  77296. }
  77297. },
  77298. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_25": {
  77299. "hide_name": 0,
  77300. "type": "SB_DFFE",
  77301. "parameters": {
  77302. },
  77303. "attributes": {
  77304. "module_not_derived": "00000000000000000000000000000001",
  77305. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77306. },
  77307. "port_directions": {
  77308. "C": "input",
  77309. "D": "input",
  77310. "E": "input",
  77311. "Q": "output"
  77312. },
  77313. "connections": {
  77314. "C": [ 42 ],
  77315. "D": [ 3000 ],
  77316. "E": [ 942 ],
  77317. "Q": [ 701 ]
  77318. }
  77319. },
  77320. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_26": {
  77321. "hide_name": 0,
  77322. "type": "SB_DFFE",
  77323. "parameters": {
  77324. },
  77325. "attributes": {
  77326. "module_not_derived": "00000000000000000000000000000001",
  77327. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77328. },
  77329. "port_directions": {
  77330. "C": "input",
  77331. "D": "input",
  77332. "E": "input",
  77333. "Q": "output"
  77334. },
  77335. "connections": {
  77336. "C": [ 42 ],
  77337. "D": [ 2973 ],
  77338. "E": [ 942 ],
  77339. "Q": [ 704 ]
  77340. }
  77341. },
  77342. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_27": {
  77343. "hide_name": 0,
  77344. "type": "SB_DFFE",
  77345. "parameters": {
  77346. },
  77347. "attributes": {
  77348. "module_not_derived": "00000000000000000000000000000001",
  77349. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77350. },
  77351. "port_directions": {
  77352. "C": "input",
  77353. "D": "input",
  77354. "E": "input",
  77355. "Q": "output"
  77356. },
  77357. "connections": {
  77358. "C": [ 42 ],
  77359. "D": [ 2761 ],
  77360. "E": [ 942 ],
  77361. "Q": [ 706 ]
  77362. }
  77363. },
  77364. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_28": {
  77365. "hide_name": 0,
  77366. "type": "SB_DFFE",
  77367. "parameters": {
  77368. },
  77369. "attributes": {
  77370. "module_not_derived": "00000000000000000000000000000001",
  77371. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77372. },
  77373. "port_directions": {
  77374. "C": "input",
  77375. "D": "input",
  77376. "E": "input",
  77377. "Q": "output"
  77378. },
  77379. "connections": {
  77380. "C": [ 42 ],
  77381. "D": [ 3078 ],
  77382. "E": [ 942 ],
  77383. "Q": [ 3697 ]
  77384. }
  77385. },
  77386. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_29": {
  77387. "hide_name": 0,
  77388. "type": "SB_DFFE",
  77389. "parameters": {
  77390. },
  77391. "attributes": {
  77392. "module_not_derived": "00000000000000000000000000000001",
  77393. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77394. },
  77395. "port_directions": {
  77396. "C": "input",
  77397. "D": "input",
  77398. "E": "input",
  77399. "Q": "output"
  77400. },
  77401. "connections": {
  77402. "C": [ 42 ],
  77403. "D": [ 2775 ],
  77404. "E": [ 942 ],
  77405. "Q": [ 3698 ]
  77406. }
  77407. },
  77408. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_3": {
  77409. "hide_name": 0,
  77410. "type": "SB_DFFE",
  77411. "parameters": {
  77412. },
  77413. "attributes": {
  77414. "module_not_derived": "00000000000000000000000000000001",
  77415. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77416. },
  77417. "port_directions": {
  77418. "C": "input",
  77419. "D": "input",
  77420. "E": "input",
  77421. "Q": "output"
  77422. },
  77423. "connections": {
  77424. "C": [ 42 ],
  77425. "D": [ 3699 ],
  77426. "E": [ 942 ],
  77427. "Q": [ 894 ]
  77428. }
  77429. },
  77430. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_4": {
  77431. "hide_name": 0,
  77432. "type": "SB_DFFE",
  77433. "parameters": {
  77434. },
  77435. "attributes": {
  77436. "module_not_derived": "00000000000000000000000000000001",
  77437. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77438. },
  77439. "port_directions": {
  77440. "C": "input",
  77441. "D": "input",
  77442. "E": "input",
  77443. "Q": "output"
  77444. },
  77445. "connections": {
  77446. "C": [ 42 ],
  77447. "D": [ 3700 ],
  77448. "E": [ 942 ],
  77449. "Q": [ 689 ]
  77450. }
  77451. },
  77452. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_5": {
  77453. "hide_name": 0,
  77454. "type": "SB_DFFE",
  77455. "parameters": {
  77456. },
  77457. "attributes": {
  77458. "module_not_derived": "00000000000000000000000000000001",
  77459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77460. },
  77461. "port_directions": {
  77462. "C": "input",
  77463. "D": "input",
  77464. "E": "input",
  77465. "Q": "output"
  77466. },
  77467. "connections": {
  77468. "C": [ 42 ],
  77469. "D": [ 3701 ],
  77470. "E": [ 942 ],
  77471. "Q": [ 687 ]
  77472. }
  77473. },
  77474. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_6": {
  77475. "hide_name": 0,
  77476. "type": "SB_DFFE",
  77477. "parameters": {
  77478. },
  77479. "attributes": {
  77480. "module_not_derived": "00000000000000000000000000000001",
  77481. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77482. },
  77483. "port_directions": {
  77484. "C": "input",
  77485. "D": "input",
  77486. "E": "input",
  77487. "Q": "output"
  77488. },
  77489. "connections": {
  77490. "C": [ 42 ],
  77491. "D": [ 2949 ],
  77492. "E": [ 942 ],
  77493. "Q": [ 730 ]
  77494. }
  77495. },
  77496. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_7": {
  77497. "hide_name": 0,
  77498. "type": "SB_DFFE",
  77499. "parameters": {
  77500. },
  77501. "attributes": {
  77502. "module_not_derived": "00000000000000000000000000000001",
  77503. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77504. },
  77505. "port_directions": {
  77506. "C": "input",
  77507. "D": "input",
  77508. "E": "input",
  77509. "Q": "output"
  77510. },
  77511. "connections": {
  77512. "C": [ 42 ],
  77513. "D": [ 3702 ],
  77514. "E": [ 942 ],
  77515. "Q": [ 728 ]
  77516. }
  77517. },
  77518. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_8": {
  77519. "hide_name": 0,
  77520. "type": "SB_DFFE",
  77521. "parameters": {
  77522. },
  77523. "attributes": {
  77524. "module_not_derived": "00000000000000000000000000000001",
  77525. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77526. },
  77527. "port_directions": {
  77528. "C": "input",
  77529. "D": "input",
  77530. "E": "input",
  77531. "Q": "output"
  77532. },
  77533. "connections": {
  77534. "C": [ 42 ],
  77535. "D": [ 3703 ],
  77536. "E": [ 942 ],
  77537. "Q": [ 726 ]
  77538. }
  77539. },
  77540. "cpu_I.dBus_cmd_halfPipe_regs_payload_address_SB_DFFE_Q_9": {
  77541. "hide_name": 0,
  77542. "type": "SB_DFFE",
  77543. "parameters": {
  77544. },
  77545. "attributes": {
  77546. "module_not_derived": "00000000000000000000000000000001",
  77547. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77548. },
  77549. "port_directions": {
  77550. "C": "input",
  77551. "D": "input",
  77552. "E": "input",
  77553. "Q": "output"
  77554. },
  77555. "connections": {
  77556. "C": [ 42 ],
  77557. "D": [ 2929 ],
  77558. "E": [ 942 ],
  77559. "Q": [ 724 ]
  77560. }
  77561. },
  77562. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q": {
  77563. "hide_name": 0,
  77564. "type": "SB_DFFE",
  77565. "parameters": {
  77566. },
  77567. "attributes": {
  77568. "module_not_derived": "00000000000000000000000000000001",
  77569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77570. },
  77571. "port_directions": {
  77572. "C": "input",
  77573. "D": "input",
  77574. "E": "input",
  77575. "Q": "output"
  77576. },
  77577. "connections": {
  77578. "C": [ 42 ],
  77579. "D": [ 3663 ],
  77580. "E": [ 942 ],
  77581. "Q": [ 110 ]
  77582. }
  77583. },
  77584. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_1": {
  77585. "hide_name": 0,
  77586. "type": "SB_DFFE",
  77587. "parameters": {
  77588. },
  77589. "attributes": {
  77590. "module_not_derived": "00000000000000000000000000000001",
  77591. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77592. },
  77593. "port_directions": {
  77594. "C": "input",
  77595. "D": "input",
  77596. "E": "input",
  77597. "Q": "output"
  77598. },
  77599. "connections": {
  77600. "C": [ 42 ],
  77601. "D": [ 3660 ],
  77602. "E": [ 942 ],
  77603. "Q": [ 102 ]
  77604. }
  77605. },
  77606. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_10": {
  77607. "hide_name": 0,
  77608. "type": "SB_DFFE",
  77609. "parameters": {
  77610. },
  77611. "attributes": {
  77612. "module_not_derived": "00000000000000000000000000000001",
  77613. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77614. },
  77615. "port_directions": {
  77616. "C": "input",
  77617. "D": "input",
  77618. "E": "input",
  77619. "Q": "output"
  77620. },
  77621. "connections": {
  77622. "C": [ 42 ],
  77623. "D": [ 3669 ],
  77624. "E": [ 942 ],
  77625. "Q": [ 105 ]
  77626. }
  77627. },
  77628. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_11": {
  77629. "hide_name": 0,
  77630. "type": "SB_DFFE",
  77631. "parameters": {
  77632. },
  77633. "attributes": {
  77634. "module_not_derived": "00000000000000000000000000000001",
  77635. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77636. },
  77637. "port_directions": {
  77638. "C": "input",
  77639. "D": "input",
  77640. "E": "input",
  77641. "Q": "output"
  77642. },
  77643. "connections": {
  77644. "C": [ 42 ],
  77645. "D": [ 3670 ],
  77646. "E": [ 942 ],
  77647. "Q": [ 97 ]
  77648. }
  77649. },
  77650. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_12": {
  77651. "hide_name": 0,
  77652. "type": "SB_DFFE",
  77653. "parameters": {
  77654. },
  77655. "attributes": {
  77656. "module_not_derived": "00000000000000000000000000000001",
  77657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77658. },
  77659. "port_directions": {
  77660. "C": "input",
  77661. "D": "input",
  77662. "E": "input",
  77663. "Q": "output"
  77664. },
  77665. "connections": {
  77666. "C": [ 42 ],
  77667. "D": [ 3673 ],
  77668. "E": [ 942 ],
  77669. "Q": [ 107 ]
  77670. }
  77671. },
  77672. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_13": {
  77673. "hide_name": 0,
  77674. "type": "SB_DFFE",
  77675. "parameters": {
  77676. },
  77677. "attributes": {
  77678. "module_not_derived": "00000000000000000000000000000001",
  77679. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77680. },
  77681. "port_directions": {
  77682. "C": "input",
  77683. "D": "input",
  77684. "E": "input",
  77685. "Q": "output"
  77686. },
  77687. "connections": {
  77688. "C": [ 42 ],
  77689. "D": [ 3675 ],
  77690. "E": [ 942 ],
  77691. "Q": [ 99 ]
  77692. }
  77693. },
  77694. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_14": {
  77695. "hide_name": 0,
  77696. "type": "SB_DFFE",
  77697. "parameters": {
  77698. },
  77699. "attributes": {
  77700. "module_not_derived": "00000000000000000000000000000001",
  77701. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77702. },
  77703. "port_directions": {
  77704. "C": "input",
  77705. "D": "input",
  77706. "E": "input",
  77707. "Q": "output"
  77708. },
  77709. "connections": {
  77710. "C": [ 42 ],
  77711. "D": [ 3677 ],
  77712. "E": [ 942 ],
  77713. "Q": [ 103 ]
  77714. }
  77715. },
  77716. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_15": {
  77717. "hide_name": 0,
  77718. "type": "SB_DFFE",
  77719. "parameters": {
  77720. },
  77721. "attributes": {
  77722. "module_not_derived": "00000000000000000000000000000001",
  77723. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77724. },
  77725. "port_directions": {
  77726. "C": "input",
  77727. "D": "input",
  77728. "E": "input",
  77729. "Q": "output"
  77730. },
  77731. "connections": {
  77732. "C": [ 42 ],
  77733. "D": [ 3678 ],
  77734. "E": [ 942 ],
  77735. "Q": [ 95 ]
  77736. }
  77737. },
  77738. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_16": {
  77739. "hide_name": 0,
  77740. "type": "SB_DFFE",
  77741. "parameters": {
  77742. },
  77743. "attributes": {
  77744. "module_not_derived": "00000000000000000000000000000001",
  77745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77746. },
  77747. "port_directions": {
  77748. "C": "input",
  77749. "D": "input",
  77750. "E": "input",
  77751. "Q": "output"
  77752. },
  77753. "connections": {
  77754. "C": [ 42 ],
  77755. "D": [ 3683 ],
  77756. "E": [ 942 ],
  77757. "Q": [ 75 ]
  77758. }
  77759. },
  77760. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_17": {
  77761. "hide_name": 0,
  77762. "type": "SB_DFFE",
  77763. "parameters": {
  77764. },
  77765. "attributes": {
  77766. "module_not_derived": "00000000000000000000000000000001",
  77767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77768. },
  77769. "port_directions": {
  77770. "C": "input",
  77771. "D": "input",
  77772. "E": "input",
  77773. "Q": "output"
  77774. },
  77775. "connections": {
  77776. "C": [ 42 ],
  77777. "D": [ 3682 ],
  77778. "E": [ 942 ],
  77779. "Q": [ 67 ]
  77780. }
  77781. },
  77782. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_18": {
  77783. "hide_name": 0,
  77784. "type": "SB_DFFE",
  77785. "parameters": {
  77786. },
  77787. "attributes": {
  77788. "module_not_derived": "00000000000000000000000000000001",
  77789. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77790. },
  77791. "port_directions": {
  77792. "C": "input",
  77793. "D": "input",
  77794. "E": "input",
  77795. "Q": "output"
  77796. },
  77797. "connections": {
  77798. "C": [ 42 ],
  77799. "D": [ 3681 ],
  77800. "E": [ 942 ],
  77801. "Q": [ 71 ]
  77802. }
  77803. },
  77804. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_19": {
  77805. "hide_name": 0,
  77806. "type": "SB_DFFE",
  77807. "parameters": {
  77808. },
  77809. "attributes": {
  77810. "module_not_derived": "00000000000000000000000000000001",
  77811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77812. },
  77813. "port_directions": {
  77814. "C": "input",
  77815. "D": "input",
  77816. "E": "input",
  77817. "Q": "output"
  77818. },
  77819. "connections": {
  77820. "C": [ 42 ],
  77821. "D": [ 3680 ],
  77822. "E": [ 942 ],
  77823. "Q": [ 63 ]
  77824. }
  77825. },
  77826. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_2": {
  77827. "hide_name": 0,
  77828. "type": "SB_DFFE",
  77829. "parameters": {
  77830. },
  77831. "attributes": {
  77832. "module_not_derived": "00000000000000000000000000000001",
  77833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77834. },
  77835. "port_directions": {
  77836. "C": "input",
  77837. "D": "input",
  77838. "E": "input",
  77839. "Q": "output"
  77840. },
  77841. "connections": {
  77842. "C": [ 42 ],
  77843. "D": [ 3656 ],
  77844. "E": [ 942 ],
  77845. "Q": [ 106 ]
  77846. }
  77847. },
  77848. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_20": {
  77849. "hide_name": 0,
  77850. "type": "SB_DFFE",
  77851. "parameters": {
  77852. },
  77853. "attributes": {
  77854. "module_not_derived": "00000000000000000000000000000001",
  77855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77856. },
  77857. "port_directions": {
  77858. "C": "input",
  77859. "D": "input",
  77860. "E": "input",
  77861. "Q": "output"
  77862. },
  77863. "connections": {
  77864. "C": [ 42 ],
  77865. "D": [ 3679 ],
  77866. "E": [ 942 ],
  77867. "Q": [ 73 ]
  77868. }
  77869. },
  77870. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_21": {
  77871. "hide_name": 0,
  77872. "type": "SB_DFFE",
  77873. "parameters": {
  77874. },
  77875. "attributes": {
  77876. "module_not_derived": "00000000000000000000000000000001",
  77877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77878. },
  77879. "port_directions": {
  77880. "C": "input",
  77881. "D": "input",
  77882. "E": "input",
  77883. "Q": "output"
  77884. },
  77885. "connections": {
  77886. "C": [ 42 ],
  77887. "D": [ 3671 ],
  77888. "E": [ 942 ],
  77889. "Q": [ 65 ]
  77890. }
  77891. },
  77892. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_22": {
  77893. "hide_name": 0,
  77894. "type": "SB_DFFE",
  77895. "parameters": {
  77896. },
  77897. "attributes": {
  77898. "module_not_derived": "00000000000000000000000000000001",
  77899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77900. },
  77901. "port_directions": {
  77902. "C": "input",
  77903. "D": "input",
  77904. "E": "input",
  77905. "Q": "output"
  77906. },
  77907. "connections": {
  77908. "C": [ 42 ],
  77909. "D": [ 3642 ],
  77910. "E": [ 942 ],
  77911. "Q": [ 69 ]
  77912. }
  77913. },
  77914. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_23": {
  77915. "hide_name": 0,
  77916. "type": "SB_DFFE",
  77917. "parameters": {
  77918. },
  77919. "attributes": {
  77920. "module_not_derived": "00000000000000000000000000000001",
  77921. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77922. },
  77923. "port_directions": {
  77924. "C": "input",
  77925. "D": "input",
  77926. "E": "input",
  77927. "Q": "output"
  77928. },
  77929. "connections": {
  77930. "C": [ 42 ],
  77931. "D": [ 3640 ],
  77932. "E": [ 942 ],
  77933. "Q": [ 61 ]
  77934. }
  77935. },
  77936. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_24": {
  77937. "hide_name": 0,
  77938. "type": "SB_DFFE",
  77939. "parameters": {
  77940. },
  77941. "attributes": {
  77942. "module_not_derived": "00000000000000000000000000000001",
  77943. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77944. },
  77945. "port_directions": {
  77946. "C": "input",
  77947. "D": "input",
  77948. "E": "input",
  77949. "Q": "output"
  77950. },
  77951. "connections": {
  77952. "C": [ 42 ],
  77953. "D": [ 3047 ],
  77954. "E": [ 942 ],
  77955. "Q": [ 74 ]
  77956. }
  77957. },
  77958. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_25": {
  77959. "hide_name": 0,
  77960. "type": "SB_DFFE",
  77961. "parameters": {
  77962. },
  77963. "attributes": {
  77964. "module_not_derived": "00000000000000000000000000000001",
  77965. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77966. },
  77967. "port_directions": {
  77968. "C": "input",
  77969. "D": "input",
  77970. "E": "input",
  77971. "Q": "output"
  77972. },
  77973. "connections": {
  77974. "C": [ 42 ],
  77975. "D": [ 3036 ],
  77976. "E": [ 942 ],
  77977. "Q": [ 66 ]
  77978. }
  77979. },
  77980. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_26": {
  77981. "hide_name": 0,
  77982. "type": "SB_DFFE",
  77983. "parameters": {
  77984. },
  77985. "attributes": {
  77986. "module_not_derived": "00000000000000000000000000000001",
  77987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  77988. },
  77989. "port_directions": {
  77990. "C": "input",
  77991. "D": "input",
  77992. "E": "input",
  77993. "Q": "output"
  77994. },
  77995. "connections": {
  77996. "C": [ 42 ],
  77997. "D": [ 3022 ],
  77998. "E": [ 942 ],
  77999. "Q": [ 70 ]
  78000. }
  78001. },
  78002. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_27": {
  78003. "hide_name": 0,
  78004. "type": "SB_DFFE",
  78005. "parameters": {
  78006. },
  78007. "attributes": {
  78008. "module_not_derived": "00000000000000000000000000000001",
  78009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78010. },
  78011. "port_directions": {
  78012. "C": "input",
  78013. "D": "input",
  78014. "E": "input",
  78015. "Q": "output"
  78016. },
  78017. "connections": {
  78018. "C": [ 42 ],
  78019. "D": [ 3653 ],
  78020. "E": [ 942 ],
  78021. "Q": [ 62 ]
  78022. }
  78023. },
  78024. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_28": {
  78025. "hide_name": 0,
  78026. "type": "SB_DFFE",
  78027. "parameters": {
  78028. },
  78029. "attributes": {
  78030. "module_not_derived": "00000000000000000000000000000001",
  78031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78032. },
  78033. "port_directions": {
  78034. "C": "input",
  78035. "D": "input",
  78036. "E": "input",
  78037. "Q": "output"
  78038. },
  78039. "connections": {
  78040. "C": [ 42 ],
  78041. "D": [ 3650 ],
  78042. "E": [ 942 ],
  78043. "Q": [ 72 ]
  78044. }
  78045. },
  78046. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_29": {
  78047. "hide_name": 0,
  78048. "type": "SB_DFFE",
  78049. "parameters": {
  78050. },
  78051. "attributes": {
  78052. "module_not_derived": "00000000000000000000000000000001",
  78053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78054. },
  78055. "port_directions": {
  78056. "C": "input",
  78057. "D": "input",
  78058. "E": "input",
  78059. "Q": "output"
  78060. },
  78061. "connections": {
  78062. "C": [ 42 ],
  78063. "D": [ 3646 ],
  78064. "E": [ 942 ],
  78065. "Q": [ 64 ]
  78066. }
  78067. },
  78068. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_3": {
  78069. "hide_name": 0,
  78070. "type": "SB_DFFE",
  78071. "parameters": {
  78072. },
  78073. "attributes": {
  78074. "module_not_derived": "00000000000000000000000000000001",
  78075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78076. },
  78077. "port_directions": {
  78078. "C": "input",
  78079. "D": "input",
  78080. "E": "input",
  78081. "Q": "output"
  78082. },
  78083. "connections": {
  78084. "C": [ 42 ],
  78085. "D": [ 3652 ],
  78086. "E": [ 942 ],
  78087. "Q": [ 98 ]
  78088. }
  78089. },
  78090. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_30": {
  78091. "hide_name": 0,
  78092. "type": "SB_DFFE",
  78093. "parameters": {
  78094. },
  78095. "attributes": {
  78096. "module_not_derived": "00000000000000000000000000000001",
  78097. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78098. },
  78099. "port_directions": {
  78100. "C": "input",
  78101. "D": "input",
  78102. "E": "input",
  78103. "Q": "output"
  78104. },
  78105. "connections": {
  78106. "C": [ 42 ],
  78107. "D": [ 2535 ],
  78108. "E": [ 942 ],
  78109. "Q": [ 68 ]
  78110. }
  78111. },
  78112. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_31": {
  78113. "hide_name": 0,
  78114. "type": "SB_DFFE",
  78115. "parameters": {
  78116. },
  78117. "attributes": {
  78118. "module_not_derived": "00000000000000000000000000000001",
  78119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78120. },
  78121. "port_directions": {
  78122. "C": "input",
  78123. "D": "input",
  78124. "E": "input",
  78125. "Q": "output"
  78126. },
  78127. "connections": {
  78128. "C": [ 42 ],
  78129. "D": [ 3639 ],
  78130. "E": [ 942 ],
  78131. "Q": [ 60 ]
  78132. }
  78133. },
  78134. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_4": {
  78135. "hide_name": 0,
  78136. "type": "SB_DFFE",
  78137. "parameters": {
  78138. },
  78139. "attributes": {
  78140. "module_not_derived": "00000000000000000000000000000001",
  78141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78142. },
  78143. "port_directions": {
  78144. "C": "input",
  78145. "D": "input",
  78146. "E": "input",
  78147. "Q": "output"
  78148. },
  78149. "connections": {
  78150. "C": [ 42 ],
  78151. "D": [ 3649 ],
  78152. "E": [ 942 ],
  78153. "Q": [ 108 ]
  78154. }
  78155. },
  78156. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_5": {
  78157. "hide_name": 0,
  78158. "type": "SB_DFFE",
  78159. "parameters": {
  78160. },
  78161. "attributes": {
  78162. "module_not_derived": "00000000000000000000000000000001",
  78163. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78164. },
  78165. "port_directions": {
  78166. "C": "input",
  78167. "D": "input",
  78168. "E": "input",
  78169. "Q": "output"
  78170. },
  78171. "connections": {
  78172. "C": [ 42 ],
  78173. "D": [ 3645 ],
  78174. "E": [ 942 ],
  78175. "Q": [ 100 ]
  78176. }
  78177. },
  78178. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_6": {
  78179. "hide_name": 0,
  78180. "type": "SB_DFFE",
  78181. "parameters": {
  78182. },
  78183. "attributes": {
  78184. "module_not_derived": "00000000000000000000000000000001",
  78185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78186. },
  78187. "port_directions": {
  78188. "C": "input",
  78189. "D": "input",
  78190. "E": "input",
  78191. "Q": "output"
  78192. },
  78193. "connections": {
  78194. "C": [ 42 ],
  78195. "D": [ 3688 ],
  78196. "E": [ 942 ],
  78197. "Q": [ 104 ]
  78198. }
  78199. },
  78200. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_7": {
  78201. "hide_name": 0,
  78202. "type": "SB_DFFE",
  78203. "parameters": {
  78204. },
  78205. "attributes": {
  78206. "module_not_derived": "00000000000000000000000000000001",
  78207. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78208. },
  78209. "port_directions": {
  78210. "C": "input",
  78211. "D": "input",
  78212. "E": "input",
  78213. "Q": "output"
  78214. },
  78215. "connections": {
  78216. "C": [ 42 ],
  78217. "D": [ 3686 ],
  78218. "E": [ 942 ],
  78219. "Q": [ 96 ]
  78220. }
  78221. },
  78222. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_8": {
  78223. "hide_name": 0,
  78224. "type": "SB_DFFE",
  78225. "parameters": {
  78226. },
  78227. "attributes": {
  78228. "module_not_derived": "00000000000000000000000000000001",
  78229. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78230. },
  78231. "port_directions": {
  78232. "C": "input",
  78233. "D": "input",
  78234. "E": "input",
  78235. "Q": "output"
  78236. },
  78237. "connections": {
  78238. "C": [ 42 ],
  78239. "D": [ 3665 ],
  78240. "E": [ 942 ],
  78241. "Q": [ 109 ]
  78242. }
  78243. },
  78244. "cpu_I.dBus_cmd_halfPipe_regs_payload_data_SB_DFFE_Q_9": {
  78245. "hide_name": 0,
  78246. "type": "SB_DFFE",
  78247. "parameters": {
  78248. },
  78249. "attributes": {
  78250. "module_not_derived": "00000000000000000000000000000001",
  78251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78252. },
  78253. "port_directions": {
  78254. "C": "input",
  78255. "D": "input",
  78256. "E": "input",
  78257. "Q": "output"
  78258. },
  78259. "connections": {
  78260. "C": [ 42 ],
  78261. "D": [ 3667 ],
  78262. "E": [ 942 ],
  78263. "Q": [ 101 ]
  78264. }
  78265. },
  78266. "cpu_I.dBus_cmd_halfPipe_regs_payload_size_SB_DFFE_Q": {
  78267. "hide_name": 0,
  78268. "type": "SB_DFFE",
  78269. "parameters": {
  78270. },
  78271. "attributes": {
  78272. "module_not_derived": "00000000000000000000000000000001",
  78273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78274. },
  78275. "port_directions": {
  78276. "C": "input",
  78277. "D": "input",
  78278. "E": "input",
  78279. "Q": "output"
  78280. },
  78281. "connections": {
  78282. "C": [ 42 ],
  78283. "D": [ 964 ],
  78284. "E": [ 942 ],
  78285. "Q": [ 3704 ]
  78286. }
  78287. },
  78288. "cpu_I.dBus_cmd_halfPipe_regs_payload_size_SB_DFFE_Q_1": {
  78289. "hide_name": 0,
  78290. "type": "SB_DFFE",
  78291. "parameters": {
  78292. },
  78293. "attributes": {
  78294. "module_not_derived": "00000000000000000000000000000001",
  78295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78296. },
  78297. "port_directions": {
  78298. "C": "input",
  78299. "D": "input",
  78300. "E": "input",
  78301. "Q": "output"
  78302. },
  78303. "connections": {
  78304. "C": [ 42 ],
  78305. "D": [ 966 ],
  78306. "E": [ 942 ],
  78307. "Q": [ 3705 ]
  78308. }
  78309. },
  78310. "cpu_I.dBus_cmd_halfPipe_regs_payload_wr_SB_DFFE_Q": {
  78311. "hide_name": 0,
  78312. "type": "SB_DFFE",
  78313. "parameters": {
  78314. },
  78315. "attributes": {
  78316. "module_not_derived": "00000000000000000000000000000001",
  78317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78318. },
  78319. "port_directions": {
  78320. "C": "input",
  78321. "D": "input",
  78322. "E": "input",
  78323. "Q": "output"
  78324. },
  78325. "connections": {
  78326. "C": [ 42 ],
  78327. "D": [ 982 ],
  78328. "E": [ 942 ],
  78329. "Q": [ 469 ]
  78330. }
  78331. },
  78332. "cpu_I.dBus_cmd_payload_wr_SB_DFFE_Q": {
  78333. "hide_name": 0,
  78334. "type": "SB_DFFE",
  78335. "parameters": {
  78336. },
  78337. "attributes": {
  78338. "module_not_derived": "00000000000000000000000000000001",
  78339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  78340. },
  78341. "port_directions": {
  78342. "C": "input",
  78343. "D": "input",
  78344. "E": "input",
  78345. "Q": "output"
  78346. },
  78347. "connections": {
  78348. "C": [ 42 ],
  78349. "D": [ 2329 ],
  78350. "E": [ 2263 ],
  78351. "Q": [ 982 ]
  78352. }
  78353. },
  78354. "cpu_I.decode_BRANCH_CTRL_SB_LUT4_O": {
  78355. "hide_name": 0,
  78356. "type": "SB_LUT4",
  78357. "parameters": {
  78358. "LUT_INIT": "1010001110100000"
  78359. },
  78360. "attributes": {
  78361. "module_not_derived": "00000000000000000000000000000001",
  78362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  78363. },
  78364. "port_directions": {
  78365. "I0": "input",
  78366. "I1": "input",
  78367. "I2": "input",
  78368. "I3": "input",
  78369. "O": "output"
  78370. },
  78371. "connections": {
  78372. "I0": [ 1363 ],
  78373. "I1": [ 1543 ],
  78374. "I2": [ 1364 ],
  78375. "I3": [ 2328 ],
  78376. "O": [ 1823 ]
  78377. }
  78378. },
  78379. "cpu_I.decode_CSR_WRITE_OPCODE_SB_LUT4_O": {
  78380. "hide_name": 0,
  78381. "type": "SB_LUT4",
  78382. "parameters": {
  78383. "LUT_INIT": "1100111111111111"
  78384. },
  78385. "attributes": {
  78386. "module_not_derived": "00000000000000000000000000000001",
  78387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78388. },
  78389. "port_directions": {
  78390. "I0": "input",
  78391. "I1": "input",
  78392. "I2": "input",
  78393. "I3": "input",
  78394. "O": "output"
  78395. },
  78396. "connections": {
  78397. "I0": [ "0" ],
  78398. "I1": [ 1535 ],
  78399. "I2": [ 1537 ],
  78400. "I3": [ 3706 ],
  78401. "O": [ 3707 ]
  78402. }
  78403. },
  78404. "cpu_I.decode_CSR_WRITE_OPCODE_SB_LUT4_O_I3_SB_LUT4_O": {
  78405. "hide_name": 0,
  78406. "type": "SB_LUT4",
  78407. "parameters": {
  78408. "LUT_INIT": "0000000000000001"
  78409. },
  78410. "attributes": {
  78411. "module_not_derived": "00000000000000000000000000000001",
  78412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  78413. },
  78414. "port_directions": {
  78415. "I0": "input",
  78416. "I1": "input",
  78417. "I2": "input",
  78418. "I3": "input",
  78419. "O": "output"
  78420. },
  78421. "connections": {
  78422. "I0": [ 1531 ],
  78423. "I1": [ 1532 ],
  78424. "I2": [ 1533 ],
  78425. "I3": [ 1534 ],
  78426. "O": [ 3706 ]
  78427. }
  78428. },
  78429. "cpu_I.decode_RS1_SB_LUT4_O": {
  78430. "hide_name": 0,
  78431. "type": "SB_LUT4",
  78432. "parameters": {
  78433. "LUT_INIT": "1100111100000011"
  78434. },
  78435. "attributes": {
  78436. "module_not_derived": "00000000000000000000000000000001",
  78437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78438. },
  78439. "port_directions": {
  78440. "I0": "input",
  78441. "I1": "input",
  78442. "I2": "input",
  78443. "I3": "input",
  78444. "O": "output"
  78445. },
  78446. "connections": {
  78447. "I0": [ "0" ],
  78448. "I1": [ 3708 ],
  78449. "I2": [ 3709 ],
  78450. "I3": [ 2970 ],
  78451. "O": [ 3710 ]
  78452. }
  78453. },
  78454. "cpu_I.decode_RS1_SB_LUT4_O_1": {
  78455. "hide_name": 0,
  78456. "type": "SB_LUT4",
  78457. "parameters": {
  78458. "LUT_INIT": "1111001111000000"
  78459. },
  78460. "attributes": {
  78461. "module_not_derived": "00000000000000000000000000000001",
  78462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78463. },
  78464. "port_directions": {
  78465. "I0": "input",
  78466. "I1": "input",
  78467. "I2": "input",
  78468. "I3": "input",
  78469. "O": "output"
  78470. },
  78471. "connections": {
  78472. "I0": [ "0" ],
  78473. "I1": [ 3708 ],
  78474. "I2": [ 3064 ],
  78475. "I3": [ 3711 ],
  78476. "O": [ 3712 ]
  78477. }
  78478. },
  78479. "cpu_I.decode_RS1_SB_LUT4_O_10": {
  78480. "hide_name": 0,
  78481. "type": "SB_LUT4",
  78482. "parameters": {
  78483. "LUT_INIT": "1111001111000000"
  78484. },
  78485. "attributes": {
  78486. "module_not_derived": "00000000000000000000000000000001",
  78487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78488. },
  78489. "port_directions": {
  78490. "I0": "input",
  78491. "I1": "input",
  78492. "I2": "input",
  78493. "I3": "input",
  78494. "O": "output"
  78495. },
  78496. "connections": {
  78497. "I0": [ "0" ],
  78498. "I1": [ 3708 ],
  78499. "I2": [ 2861 ],
  78500. "I3": [ 3713 ],
  78501. "O": [ 3714 ]
  78502. }
  78503. },
  78504. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O": {
  78505. "hide_name": 0,
  78506. "type": "SB_LUT4",
  78507. "parameters": {
  78508. "LUT_INIT": "1111001111000000"
  78509. },
  78510. "attributes": {
  78511. "module_not_derived": "00000000000000000000000000000001",
  78512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78513. },
  78514. "port_directions": {
  78515. "I0": "input",
  78516. "I1": "input",
  78517. "I2": "input",
  78518. "I3": "input",
  78519. "O": "output"
  78520. },
  78521. "connections": {
  78522. "I0": [ "0" ],
  78523. "I1": [ 3715 ],
  78524. "I2": [ 3196 ],
  78525. "I3": [ 3716 ],
  78526. "O": [ 3713 ]
  78527. }
  78528. },
  78529. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  78530. "hide_name": 0,
  78531. "type": "SB_LUT4",
  78532. "parameters": {
  78533. "LUT_INIT": "1111110000110000"
  78534. },
  78535. "attributes": {
  78536. "module_not_derived": "00000000000000000000000000000001",
  78537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78538. },
  78539. "port_directions": {
  78540. "I0": "input",
  78541. "I1": "input",
  78542. "I2": "input",
  78543. "I3": "input",
  78544. "O": "output"
  78545. },
  78546. "connections": {
  78547. "I0": [ "0" ],
  78548. "I1": [ 2323 ],
  78549. "I2": [ 3717 ],
  78550. "I3": [ 2291 ],
  78551. "O": [ 3716 ]
  78552. }
  78553. },
  78554. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  78555. "hide_name": 0,
  78556. "type": "SB_LUT4",
  78557. "parameters": {
  78558. "LUT_INIT": "1100110000001111"
  78559. },
  78560. "attributes": {
  78561. "module_not_derived": "00000000000000000000000000000001",
  78562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78563. },
  78564. "port_directions": {
  78565. "I0": "input",
  78566. "I1": "input",
  78567. "I2": "input",
  78568. "I3": "input",
  78569. "O": "output"
  78570. },
  78571. "connections": {
  78572. "I0": [ "0" ],
  78573. "I1": [ 2063 ],
  78574. "I2": [ 3718 ],
  78575. "I3": [ 2094 ],
  78576. "O": [ 3717 ]
  78577. }
  78578. },
  78579. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  78580. "hide_name": 0,
  78581. "type": "SB_LUT4",
  78582. "parameters": {
  78583. "LUT_INIT": "0000111100110011"
  78584. },
  78585. "attributes": {
  78586. "module_not_derived": "00000000000000000000000000000001",
  78587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78588. },
  78589. "port_directions": {
  78590. "I0": "input",
  78591. "I1": "input",
  78592. "I2": "input",
  78593. "I3": "input",
  78594. "O": "output"
  78595. },
  78596. "connections": {
  78597. "I0": [ "0" ],
  78598. "I1": [ 2199 ],
  78599. "I2": [ 2077 ],
  78600. "I3": [ 2089 ],
  78601. "O": [ 3718 ]
  78602. }
  78603. },
  78604. "cpu_I.decode_RS1_SB_LUT4_O_11": {
  78605. "hide_name": 0,
  78606. "type": "SB_LUT4",
  78607. "parameters": {
  78608. "LUT_INIT": "1111110000110000"
  78609. },
  78610. "attributes": {
  78611. "module_not_derived": "00000000000000000000000000000001",
  78612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78613. },
  78614. "port_directions": {
  78615. "I0": "input",
  78616. "I1": "input",
  78617. "I2": "input",
  78618. "I3": "input",
  78619. "O": "output"
  78620. },
  78621. "connections": {
  78622. "I0": [ "0" ],
  78623. "I1": [ 3708 ],
  78624. "I2": [ 3719 ],
  78625. "I3": [ 2980 ],
  78626. "O": [ 3720 ]
  78627. }
  78628. },
  78629. "cpu_I.decode_RS1_SB_LUT4_O_11_I2_SB_LUT4_O": {
  78630. "hide_name": 0,
  78631. "type": "SB_LUT4",
  78632. "parameters": {
  78633. "LUT_INIT": "1111001111000000"
  78634. },
  78635. "attributes": {
  78636. "module_not_derived": "00000000000000000000000000000001",
  78637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78638. },
  78639. "port_directions": {
  78640. "I0": "input",
  78641. "I1": "input",
  78642. "I2": "input",
  78643. "I3": "input",
  78644. "O": "output"
  78645. },
  78646. "connections": {
  78647. "I0": [ "0" ],
  78648. "I1": [ 3715 ],
  78649. "I2": [ 3203 ],
  78650. "I3": [ 3721 ],
  78651. "O": [ 3719 ]
  78652. }
  78653. },
  78654. "cpu_I.decode_RS1_SB_LUT4_O_11_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  78655. "hide_name": 0,
  78656. "type": "SB_LUT4",
  78657. "parameters": {
  78658. "LUT_INIT": "1111110000110000"
  78659. },
  78660. "attributes": {
  78661. "module_not_derived": "00000000000000000000000000000001",
  78662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78663. },
  78664. "port_directions": {
  78665. "I0": "input",
  78666. "I1": "input",
  78667. "I2": "input",
  78668. "I3": "input",
  78669. "O": "output"
  78670. },
  78671. "connections": {
  78672. "I0": [ "0" ],
  78673. "I1": [ 2323 ],
  78674. "I2": [ 2251 ],
  78675. "I3": [ 2281 ],
  78676. "O": [ 3721 ]
  78677. }
  78678. },
  78679. "cpu_I.decode_RS1_SB_LUT4_O_12": {
  78680. "hide_name": 0,
  78681. "type": "SB_LUT4",
  78682. "parameters": {
  78683. "LUT_INIT": "1111110000110000"
  78684. },
  78685. "attributes": {
  78686. "module_not_derived": "00000000000000000000000000000001",
  78687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78688. },
  78689. "port_directions": {
  78690. "I0": "input",
  78691. "I1": "input",
  78692. "I2": "input",
  78693. "I3": "input",
  78694. "O": "output"
  78695. },
  78696. "connections": {
  78697. "I0": [ "0" ],
  78698. "I1": [ 3708 ],
  78699. "I2": [ 3722 ],
  78700. "I3": [ 2984 ],
  78701. "O": [ 3723 ]
  78702. }
  78703. },
  78704. "cpu_I.decode_RS1_SB_LUT4_O_12_I2_SB_LUT4_O": {
  78705. "hide_name": 0,
  78706. "type": "SB_LUT4",
  78707. "parameters": {
  78708. "LUT_INIT": "1111001111000000"
  78709. },
  78710. "attributes": {
  78711. "module_not_derived": "00000000000000000000000000000001",
  78712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78713. },
  78714. "port_directions": {
  78715. "I0": "input",
  78716. "I1": "input",
  78717. "I2": "input",
  78718. "I3": "input",
  78719. "O": "output"
  78720. },
  78721. "connections": {
  78722. "I0": [ "0" ],
  78723. "I1": [ 3715 ],
  78724. "I2": [ 3208 ],
  78725. "I3": [ 3724 ],
  78726. "O": [ 3722 ]
  78727. }
  78728. },
  78729. "cpu_I.decode_RS1_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  78730. "hide_name": 0,
  78731. "type": "SB_LUT4",
  78732. "parameters": {
  78733. "LUT_INIT": "1111110000110000"
  78734. },
  78735. "attributes": {
  78736. "module_not_derived": "00000000000000000000000000000001",
  78737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78738. },
  78739. "port_directions": {
  78740. "I0": "input",
  78741. "I1": "input",
  78742. "I2": "input",
  78743. "I3": "input",
  78744. "O": "output"
  78745. },
  78746. "connections": {
  78747. "I0": [ "0" ],
  78748. "I1": [ 2323 ],
  78749. "I2": [ 2245 ],
  78750. "I3": [ 2292 ],
  78751. "O": [ 3724 ]
  78752. }
  78753. },
  78754. "cpu_I.decode_RS1_SB_LUT4_O_13": {
  78755. "hide_name": 0,
  78756. "type": "SB_LUT4",
  78757. "parameters": {
  78758. "LUT_INIT": "1111110000110000"
  78759. },
  78760. "attributes": {
  78761. "module_not_derived": "00000000000000000000000000000001",
  78762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78763. },
  78764. "port_directions": {
  78765. "I0": "input",
  78766. "I1": "input",
  78767. "I2": "input",
  78768. "I3": "input",
  78769. "O": "output"
  78770. },
  78771. "connections": {
  78772. "I0": [ "0" ],
  78773. "I1": [ 3708 ],
  78774. "I2": [ 3725 ],
  78775. "I3": [ 2966 ],
  78776. "O": [ 3726 ]
  78777. }
  78778. },
  78779. "cpu_I.decode_RS1_SB_LUT4_O_13_I2_SB_LUT4_O": {
  78780. "hide_name": 0,
  78781. "type": "SB_LUT4",
  78782. "parameters": {
  78783. "LUT_INIT": "1111001111000000"
  78784. },
  78785. "attributes": {
  78786. "module_not_derived": "00000000000000000000000000000001",
  78787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78788. },
  78789. "port_directions": {
  78790. "I0": "input",
  78791. "I1": "input",
  78792. "I2": "input",
  78793. "I3": "input",
  78794. "O": "output"
  78795. },
  78796. "connections": {
  78797. "I0": [ "0" ],
  78798. "I1": [ 3715 ],
  78799. "I2": [ 3167 ],
  78800. "I3": [ 3727 ],
  78801. "O": [ 3725 ]
  78802. }
  78803. },
  78804. "cpu_I.decode_RS1_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  78805. "hide_name": 0,
  78806. "type": "SB_LUT4",
  78807. "parameters": {
  78808. "LUT_INIT": "1111110000110000"
  78809. },
  78810. "attributes": {
  78811. "module_not_derived": "00000000000000000000000000000001",
  78812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78813. },
  78814. "port_directions": {
  78815. "I0": "input",
  78816. "I1": "input",
  78817. "I2": "input",
  78818. "I3": "input",
  78819. "O": "output"
  78820. },
  78821. "connections": {
  78822. "I0": [ "0" ],
  78823. "I1": [ 2323 ],
  78824. "I2": [ 2249 ],
  78825. "I3": [ 2295 ],
  78826. "O": [ 3727 ]
  78827. }
  78828. },
  78829. "cpu_I.decode_RS1_SB_LUT4_O_14": {
  78830. "hide_name": 0,
  78831. "type": "SB_LUT4",
  78832. "parameters": {
  78833. "LUT_INIT": "1111110000110000"
  78834. },
  78835. "attributes": {
  78836. "module_not_derived": "00000000000000000000000000000001",
  78837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78838. },
  78839. "port_directions": {
  78840. "I0": "input",
  78841. "I1": "input",
  78842. "I2": "input",
  78843. "I3": "input",
  78844. "O": "output"
  78845. },
  78846. "connections": {
  78847. "I0": [ "0" ],
  78848. "I1": [ 3708 ],
  78849. "I2": [ 3728 ],
  78850. "I3": [ 2963 ],
  78851. "O": [ 3729 ]
  78852. }
  78853. },
  78854. "cpu_I.decode_RS1_SB_LUT4_O_14_I2_SB_LUT4_O": {
  78855. "hide_name": 0,
  78856. "type": "SB_LUT4",
  78857. "parameters": {
  78858. "LUT_INIT": "1111001111000000"
  78859. },
  78860. "attributes": {
  78861. "module_not_derived": "00000000000000000000000000000001",
  78862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78863. },
  78864. "port_directions": {
  78865. "I0": "input",
  78866. "I1": "input",
  78867. "I2": "input",
  78868. "I3": "input",
  78869. "O": "output"
  78870. },
  78871. "connections": {
  78872. "I0": [ "0" ],
  78873. "I1": [ 3715 ],
  78874. "I2": [ 3153 ],
  78875. "I3": [ 3730 ],
  78876. "O": [ 3728 ]
  78877. }
  78878. },
  78879. "cpu_I.decode_RS1_SB_LUT4_O_14_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  78880. "hide_name": 0,
  78881. "type": "SB_LUT4",
  78882. "parameters": {
  78883. "LUT_INIT": "1111110000110000"
  78884. },
  78885. "attributes": {
  78886. "module_not_derived": "00000000000000000000000000000001",
  78887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78888. },
  78889. "port_directions": {
  78890. "I0": "input",
  78891. "I1": "input",
  78892. "I2": "input",
  78893. "I3": "input",
  78894. "O": "output"
  78895. },
  78896. "connections": {
  78897. "I0": [ "0" ],
  78898. "I1": [ 2323 ],
  78899. "I2": [ 2241 ],
  78900. "I3": [ 2296 ],
  78901. "O": [ 3730 ]
  78902. }
  78903. },
  78904. "cpu_I.decode_RS1_SB_LUT4_O_15": {
  78905. "hide_name": 0,
  78906. "type": "SB_LUT4",
  78907. "parameters": {
  78908. "LUT_INIT": "1111110000110000"
  78909. },
  78910. "attributes": {
  78911. "module_not_derived": "00000000000000000000000000000001",
  78912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78913. },
  78914. "port_directions": {
  78915. "I0": "input",
  78916. "I1": "input",
  78917. "I2": "input",
  78918. "I3": "input",
  78919. "O": "output"
  78920. },
  78921. "connections": {
  78922. "I0": [ "0" ],
  78923. "I1": [ 3708 ],
  78924. "I2": [ 3731 ],
  78925. "I3": [ 2960 ],
  78926. "O": [ 3732 ]
  78927. }
  78928. },
  78929. "cpu_I.decode_RS1_SB_LUT4_O_15_I2_SB_LUT4_O": {
  78930. "hide_name": 0,
  78931. "type": "SB_LUT4",
  78932. "parameters": {
  78933. "LUT_INIT": "1111001111000000"
  78934. },
  78935. "attributes": {
  78936. "module_not_derived": "00000000000000000000000000000001",
  78937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78938. },
  78939. "port_directions": {
  78940. "I0": "input",
  78941. "I1": "input",
  78942. "I2": "input",
  78943. "I3": "input",
  78944. "O": "output"
  78945. },
  78946. "connections": {
  78947. "I0": [ "0" ],
  78948. "I1": [ 3715 ],
  78949. "I2": [ 3146 ],
  78950. "I3": [ 3733 ],
  78951. "O": [ 3731 ]
  78952. }
  78953. },
  78954. "cpu_I.decode_RS1_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  78955. "hide_name": 0,
  78956. "type": "SB_LUT4",
  78957. "parameters": {
  78958. "LUT_INIT": "1111110000110000"
  78959. },
  78960. "attributes": {
  78961. "module_not_derived": "00000000000000000000000000000001",
  78962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78963. },
  78964. "port_directions": {
  78965. "I0": "input",
  78966. "I1": "input",
  78967. "I2": "input",
  78968. "I3": "input",
  78969. "O": "output"
  78970. },
  78971. "connections": {
  78972. "I0": [ "0" ],
  78973. "I1": [ 2323 ],
  78974. "I2": [ 2255 ],
  78975. "I3": [ 2297 ],
  78976. "O": [ 3733 ]
  78977. }
  78978. },
  78979. "cpu_I.decode_RS1_SB_LUT4_O_16": {
  78980. "hide_name": 0,
  78981. "type": "SB_LUT4",
  78982. "parameters": {
  78983. "LUT_INIT": "1111110000110000"
  78984. },
  78985. "attributes": {
  78986. "module_not_derived": "00000000000000000000000000000001",
  78987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  78988. },
  78989. "port_directions": {
  78990. "I0": "input",
  78991. "I1": "input",
  78992. "I2": "input",
  78993. "I3": "input",
  78994. "O": "output"
  78995. },
  78996. "connections": {
  78997. "I0": [ "0" ],
  78998. "I1": [ 3708 ],
  78999. "I2": [ 3734 ],
  79000. "I3": [ 2957 ],
  79001. "O": [ 3735 ]
  79002. }
  79003. },
  79004. "cpu_I.decode_RS1_SB_LUT4_O_16_I2_SB_LUT4_O": {
  79005. "hide_name": 0,
  79006. "type": "SB_LUT4",
  79007. "parameters": {
  79008. "LUT_INIT": "1111001111000000"
  79009. },
  79010. "attributes": {
  79011. "module_not_derived": "00000000000000000000000000000001",
  79012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79013. },
  79014. "port_directions": {
  79015. "I0": "input",
  79016. "I1": "input",
  79017. "I2": "input",
  79018. "I3": "input",
  79019. "O": "output"
  79020. },
  79021. "connections": {
  79022. "I0": [ "0" ],
  79023. "I1": [ 3715 ],
  79024. "I2": [ 3139 ],
  79025. "I3": [ 3736 ],
  79026. "O": [ 3734 ]
  79027. }
  79028. },
  79029. "cpu_I.decode_RS1_SB_LUT4_O_16_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  79030. "hide_name": 0,
  79031. "type": "SB_LUT4",
  79032. "parameters": {
  79033. "LUT_INIT": "1111110000110000"
  79034. },
  79035. "attributes": {
  79036. "module_not_derived": "00000000000000000000000000000001",
  79037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79038. },
  79039. "port_directions": {
  79040. "I0": "input",
  79041. "I1": "input",
  79042. "I2": "input",
  79043. "I3": "input",
  79044. "O": "output"
  79045. },
  79046. "connections": {
  79047. "I0": [ "0" ],
  79048. "I1": [ 2323 ],
  79049. "I2": [ 2247 ],
  79050. "I3": [ 2298 ],
  79051. "O": [ 3736 ]
  79052. }
  79053. },
  79054. "cpu_I.decode_RS1_SB_LUT4_O_17": {
  79055. "hide_name": 0,
  79056. "type": "SB_LUT4",
  79057. "parameters": {
  79058. "LUT_INIT": "1111110000110000"
  79059. },
  79060. "attributes": {
  79061. "module_not_derived": "00000000000000000000000000000001",
  79062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79063. },
  79064. "port_directions": {
  79065. "I0": "input",
  79066. "I1": "input",
  79067. "I2": "input",
  79068. "I3": "input",
  79069. "O": "output"
  79070. },
  79071. "connections": {
  79072. "I0": [ "0" ],
  79073. "I1": [ 3708 ],
  79074. "I2": [ 3737 ],
  79075. "I3": [ 2945 ],
  79076. "O": [ 3738 ]
  79077. }
  79078. },
  79079. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O": {
  79080. "hide_name": 0,
  79081. "type": "SB_LUT4",
  79082. "parameters": {
  79083. "LUT_INIT": "1111001111000000"
  79084. },
  79085. "attributes": {
  79086. "module_not_derived": "00000000000000000000000000000001",
  79087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79088. },
  79089. "port_directions": {
  79090. "I0": "input",
  79091. "I1": "input",
  79092. "I2": "input",
  79093. "I3": "input",
  79094. "O": "output"
  79095. },
  79096. "connections": {
  79097. "I0": [ "0" ],
  79098. "I1": [ 3715 ],
  79099. "I2": [ 3215 ],
  79100. "I3": [ 3739 ],
  79101. "O": [ 3737 ]
  79102. }
  79103. },
  79104. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  79105. "hide_name": 0,
  79106. "type": "SB_LUT4",
  79107. "parameters": {
  79108. "LUT_INIT": "1111110000110000"
  79109. },
  79110. "attributes": {
  79111. "module_not_derived": "00000000000000000000000000000001",
  79112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79113. },
  79114. "port_directions": {
  79115. "I0": "input",
  79116. "I1": "input",
  79117. "I2": "input",
  79118. "I3": "input",
  79119. "O": "output"
  79120. },
  79121. "connections": {
  79122. "I0": [ "0" ],
  79123. "I1": [ 2323 ],
  79124. "I2": [ 3740 ],
  79125. "I3": [ 2299 ],
  79126. "O": [ 3739 ]
  79127. }
  79128. },
  79129. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  79130. "hide_name": 0,
  79131. "type": "SB_LUT4",
  79132. "parameters": {
  79133. "LUT_INIT": "1100110011110000"
  79134. },
  79135. "attributes": {
  79136. "module_not_derived": "00000000000000000000000000000001",
  79137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79138. },
  79139. "port_directions": {
  79140. "I0": "input",
  79141. "I1": "input",
  79142. "I2": "input",
  79143. "I3": "input",
  79144. "O": "output"
  79145. },
  79146. "connections": {
  79147. "I0": [ "0" ],
  79148. "I1": [ 2154 ],
  79149. "I2": [ 3741 ],
  79150. "I3": [ 2094 ],
  79151. "O": [ 3740 ]
  79152. }
  79153. },
  79154. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  79155. "hide_name": 0,
  79156. "type": "SB_LUT4",
  79157. "parameters": {
  79158. "LUT_INIT": "1111000011001100"
  79159. },
  79160. "attributes": {
  79161. "module_not_derived": "00000000000000000000000000000001",
  79162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79163. },
  79164. "port_directions": {
  79165. "I0": "input",
  79166. "I1": "input",
  79167. "I2": "input",
  79168. "I3": "input",
  79169. "O": "output"
  79170. },
  79171. "connections": {
  79172. "I0": [ "0" ],
  79173. "I1": [ 2238 ],
  79174. "I2": [ 2171 ],
  79175. "I3": [ 2089 ],
  79176. "O": [ 3741 ]
  79177. }
  79178. },
  79179. "cpu_I.decode_RS1_SB_LUT4_O_18": {
  79180. "hide_name": 0,
  79181. "type": "SB_LUT4",
  79182. "parameters": {
  79183. "LUT_INIT": "1111110000110000"
  79184. },
  79185. "attributes": {
  79186. "module_not_derived": "00000000000000000000000000000001",
  79187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79188. },
  79189. "port_directions": {
  79190. "I0": "input",
  79191. "I1": "input",
  79192. "I2": "input",
  79193. "I3": "input",
  79194. "O": "output"
  79195. },
  79196. "connections": {
  79197. "I0": [ "0" ],
  79198. "I1": [ 3708 ],
  79199. "I2": [ 3742 ],
  79200. "I3": [ 2942 ],
  79201. "O": [ 3743 ]
  79202. }
  79203. },
  79204. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O": {
  79205. "hide_name": 0,
  79206. "type": "SB_LUT4",
  79207. "parameters": {
  79208. "LUT_INIT": "1111001111000000"
  79209. },
  79210. "attributes": {
  79211. "module_not_derived": "00000000000000000000000000000001",
  79212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79213. },
  79214. "port_directions": {
  79215. "I0": "input",
  79216. "I1": "input",
  79217. "I2": "input",
  79218. "I3": "input",
  79219. "O": "output"
  79220. },
  79221. "connections": {
  79222. "I0": [ "0" ],
  79223. "I1": [ 3715 ],
  79224. "I2": [ 3132 ],
  79225. "I3": [ 3744 ],
  79226. "O": [ 3742 ]
  79227. }
  79228. },
  79229. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  79230. "hide_name": 0,
  79231. "type": "SB_LUT4",
  79232. "parameters": {
  79233. "LUT_INIT": "1111110000110000"
  79234. },
  79235. "attributes": {
  79236. "module_not_derived": "00000000000000000000000000000001",
  79237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79238. },
  79239. "port_directions": {
  79240. "I0": "input",
  79241. "I1": "input",
  79242. "I2": "input",
  79243. "I3": "input",
  79244. "O": "output"
  79245. },
  79246. "connections": {
  79247. "I0": [ "0" ],
  79248. "I1": [ 2323 ],
  79249. "I2": [ 3745 ],
  79250. "I3": [ 2300 ],
  79251. "O": [ 3744 ]
  79252. }
  79253. },
  79254. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  79255. "hide_name": 0,
  79256. "type": "SB_LUT4",
  79257. "parameters": {
  79258. "LUT_INIT": "1100110011110000"
  79259. },
  79260. "attributes": {
  79261. "module_not_derived": "00000000000000000000000000000001",
  79262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79263. },
  79264. "port_directions": {
  79265. "I0": "input",
  79266. "I1": "input",
  79267. "I2": "input",
  79268. "I3": "input",
  79269. "O": "output"
  79270. },
  79271. "connections": {
  79272. "I0": [ "0" ],
  79273. "I1": [ 2146 ],
  79274. "I2": [ 3746 ],
  79275. "I3": [ 2094 ],
  79276. "O": [ 3745 ]
  79277. }
  79278. },
  79279. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  79280. "hide_name": 0,
  79281. "type": "SB_LUT4",
  79282. "parameters": {
  79283. "LUT_INIT": "1111000011001100"
  79284. },
  79285. "attributes": {
  79286. "module_not_derived": "00000000000000000000000000000001",
  79287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79288. },
  79289. "port_directions": {
  79290. "I0": "input",
  79291. "I1": "input",
  79292. "I2": "input",
  79293. "I3": "input",
  79294. "O": "output"
  79295. },
  79296. "connections": {
  79297. "I0": [ "0" ],
  79298. "I1": [ 2230 ],
  79299. "I2": [ 2185 ],
  79300. "I3": [ 2089 ],
  79301. "O": [ 3746 ]
  79302. }
  79303. },
  79304. "cpu_I.decode_RS1_SB_LUT4_O_19": {
  79305. "hide_name": 0,
  79306. "type": "SB_LUT4",
  79307. "parameters": {
  79308. "LUT_INIT": "1111110000110000"
  79309. },
  79310. "attributes": {
  79311. "module_not_derived": "00000000000000000000000000000001",
  79312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79313. },
  79314. "port_directions": {
  79315. "I0": "input",
  79316. "I1": "input",
  79317. "I2": "input",
  79318. "I3": "input",
  79319. "O": "output"
  79320. },
  79321. "connections": {
  79322. "I0": [ "0" ],
  79323. "I1": [ 3708 ],
  79324. "I2": [ 3747 ],
  79325. "I3": [ 2939 ],
  79326. "O": [ 3748 ]
  79327. }
  79328. },
  79329. "cpu_I.decode_RS1_SB_LUT4_O_19_I2_SB_LUT4_O": {
  79330. "hide_name": 0,
  79331. "type": "SB_LUT4",
  79332. "parameters": {
  79333. "LUT_INIT": "1111001111000000"
  79334. },
  79335. "attributes": {
  79336. "module_not_derived": "00000000000000000000000000000001",
  79337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79338. },
  79339. "port_directions": {
  79340. "I0": "input",
  79341. "I1": "input",
  79342. "I2": "input",
  79343. "I3": "input",
  79344. "O": "output"
  79345. },
  79346. "connections": {
  79347. "I0": [ "0" ],
  79348. "I1": [ 3715 ],
  79349. "I2": [ 3222 ],
  79350. "I3": [ 3749 ],
  79351. "O": [ 3747 ]
  79352. }
  79353. },
  79354. "cpu_I.decode_RS1_SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  79355. "hide_name": 0,
  79356. "type": "SB_LUT4",
  79357. "parameters": {
  79358. "LUT_INIT": "1111110000110000"
  79359. },
  79360. "attributes": {
  79361. "module_not_derived": "00000000000000000000000000000001",
  79362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79363. },
  79364. "port_directions": {
  79365. "I0": "input",
  79366. "I1": "input",
  79367. "I2": "input",
  79368. "I3": "input",
  79369. "O": "output"
  79370. },
  79371. "connections": {
  79372. "I0": [ "0" ],
  79373. "I1": [ 2323 ],
  79374. "I2": [ 2253 ],
  79375. "I3": [ 2271 ],
  79376. "O": [ 3749 ]
  79377. }
  79378. },
  79379. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  79380. "hide_name": 0,
  79381. "type": "SB_LUT4",
  79382. "parameters": {
  79383. "LUT_INIT": "0000000011110011"
  79384. },
  79385. "attributes": {
  79386. "module_not_derived": "00000000000000000000000000000001",
  79387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79388. },
  79389. "port_directions": {
  79390. "I0": "input",
  79391. "I1": "input",
  79392. "I2": "input",
  79393. "I3": "input",
  79394. "O": "output"
  79395. },
  79396. "connections": {
  79397. "I0": [ "0" ],
  79398. "I1": [ 3715 ],
  79399. "I2": [ 3251 ],
  79400. "I3": [ 3750 ],
  79401. "O": [ 3711 ]
  79402. }
  79403. },
  79404. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  79405. "hide_name": 0,
  79406. "type": "SB_LUT4",
  79407. "parameters": {
  79408. "LUT_INIT": "0000000101000101"
  79409. },
  79410. "attributes": {
  79411. "module_not_derived": "00000000000000000000000000000001",
  79412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  79413. },
  79414. "port_directions": {
  79415. "I0": "input",
  79416. "I1": "input",
  79417. "I2": "input",
  79418. "I3": "input",
  79419. "O": "output"
  79420. },
  79421. "connections": {
  79422. "I0": [ 3715 ],
  79423. "I1": [ 2323 ],
  79424. "I2": [ 3751 ],
  79425. "I3": [ 2284 ],
  79426. "O": [ 3750 ]
  79427. }
  79428. },
  79429. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  79430. "hide_name": 0,
  79431. "type": "SB_LUT4",
  79432. "parameters": {
  79433. "LUT_INIT": "1100110011110000"
  79434. },
  79435. "attributes": {
  79436. "module_not_derived": "00000000000000000000000000000001",
  79437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79438. },
  79439. "port_directions": {
  79440. "I0": "input",
  79441. "I1": "input",
  79442. "I2": "input",
  79443. "I3": "input",
  79444. "O": "output"
  79445. },
  79446. "connections": {
  79447. "I0": [ "0" ],
  79448. "I1": [ 2068 ],
  79449. "I2": [ 3752 ],
  79450. "I3": [ 2094 ],
  79451. "O": [ 3751 ]
  79452. }
  79453. },
  79454. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  79455. "hide_name": 0,
  79456. "type": "SB_LUT4",
  79457. "parameters": {
  79458. "LUT_INIT": "1111000011001100"
  79459. },
  79460. "attributes": {
  79461. "module_not_derived": "00000000000000000000000000000001",
  79462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79463. },
  79464. "port_directions": {
  79465. "I0": "input",
  79466. "I1": "input",
  79467. "I2": "input",
  79468. "I3": "input",
  79469. "O": "output"
  79470. },
  79471. "connections": {
  79472. "I0": [ "0" ],
  79473. "I1": [ 2204 ],
  79474. "I2": [ 2110 ],
  79475. "I3": [ 2089 ],
  79476. "O": [ 3752 ]
  79477. }
  79478. },
  79479. "cpu_I.decode_RS1_SB_LUT4_O_2": {
  79480. "hide_name": 0,
  79481. "type": "SB_LUT4",
  79482. "parameters": {
  79483. "LUT_INIT": "1111001111000000"
  79484. },
  79485. "attributes": {
  79486. "module_not_derived": "00000000000000000000000000000001",
  79487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79488. },
  79489. "port_directions": {
  79490. "I0": "input",
  79491. "I1": "input",
  79492. "I2": "input",
  79493. "I3": "input",
  79494. "O": "output"
  79495. },
  79496. "connections": {
  79497. "I0": [ "0" ],
  79498. "I1": [ 3708 ],
  79499. "I2": [ 3050 ],
  79500. "I3": [ 3753 ],
  79501. "O": [ 3754 ]
  79502. }
  79503. },
  79504. "cpu_I.decode_RS1_SB_LUT4_O_20": {
  79505. "hide_name": 0,
  79506. "type": "SB_LUT4",
  79507. "parameters": {
  79508. "LUT_INIT": "1111110000110000"
  79509. },
  79510. "attributes": {
  79511. "module_not_derived": "00000000000000000000000000000001",
  79512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79513. },
  79514. "port_directions": {
  79515. "I0": "input",
  79516. "I1": "input",
  79517. "I2": "input",
  79518. "I3": "input",
  79519. "O": "output"
  79520. },
  79521. "connections": {
  79522. "I0": [ "0" ],
  79523. "I1": [ 3708 ],
  79524. "I2": [ 3755 ],
  79525. "I3": [ 2925 ],
  79526. "O": [ 3756 ]
  79527. }
  79528. },
  79529. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O": {
  79530. "hide_name": 0,
  79531. "type": "SB_LUT4",
  79532. "parameters": {
  79533. "LUT_INIT": "1111001111000000"
  79534. },
  79535. "attributes": {
  79536. "module_not_derived": "00000000000000000000000000000001",
  79537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79538. },
  79539. "port_directions": {
  79540. "I0": "input",
  79541. "I1": "input",
  79542. "I2": "input",
  79543. "I3": "input",
  79544. "O": "output"
  79545. },
  79546. "connections": {
  79547. "I0": [ "0" ],
  79548. "I1": [ 3715 ],
  79549. "I2": [ 3125 ],
  79550. "I3": [ 3757 ],
  79551. "O": [ 3755 ]
  79552. }
  79553. },
  79554. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  79555. "hide_name": 0,
  79556. "type": "SB_LUT4",
  79557. "parameters": {
  79558. "LUT_INIT": "1111110000110000"
  79559. },
  79560. "attributes": {
  79561. "module_not_derived": "00000000000000000000000000000001",
  79562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79563. },
  79564. "port_directions": {
  79565. "I0": "input",
  79566. "I1": "input",
  79567. "I2": "input",
  79568. "I3": "input",
  79569. "O": "output"
  79570. },
  79571. "connections": {
  79572. "I0": [ "0" ],
  79573. "I1": [ 2323 ],
  79574. "I2": [ 3758 ],
  79575. "I3": [ 2272 ],
  79576. "O": [ 3757 ]
  79577. }
  79578. },
  79579. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  79580. "hide_name": 0,
  79581. "type": "SB_LUT4",
  79582. "parameters": {
  79583. "LUT_INIT": "1100110011110000"
  79584. },
  79585. "attributes": {
  79586. "module_not_derived": "00000000000000000000000000000001",
  79587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79588. },
  79589. "port_directions": {
  79590. "I0": "input",
  79591. "I1": "input",
  79592. "I2": "input",
  79593. "I3": "input",
  79594. "O": "output"
  79595. },
  79596. "connections": {
  79597. "I0": [ "0" ],
  79598. "I1": [ 2142 ],
  79599. "I2": [ 3759 ],
  79600. "I3": [ 2094 ],
  79601. "O": [ 3758 ]
  79602. }
  79603. },
  79604. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  79605. "hide_name": 0,
  79606. "type": "SB_LUT4",
  79607. "parameters": {
  79608. "LUT_INIT": "1111000011001100"
  79609. },
  79610. "attributes": {
  79611. "module_not_derived": "00000000000000000000000000000001",
  79612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79613. },
  79614. "port_directions": {
  79615. "I0": "input",
  79616. "I1": "input",
  79617. "I2": "input",
  79618. "I3": "input",
  79619. "O": "output"
  79620. },
  79621. "connections": {
  79622. "I0": [ "0" ],
  79623. "I1": [ 2226 ],
  79624. "I2": [ 2164 ],
  79625. "I3": [ 2089 ],
  79626. "O": [ 3759 ]
  79627. }
  79628. },
  79629. "cpu_I.decode_RS1_SB_LUT4_O_21": {
  79630. "hide_name": 0,
  79631. "type": "SB_LUT4",
  79632. "parameters": {
  79633. "LUT_INIT": "1111001111000000"
  79634. },
  79635. "attributes": {
  79636. "module_not_derived": "00000000000000000000000000000001",
  79637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79638. },
  79639. "port_directions": {
  79640. "I0": "input",
  79641. "I1": "input",
  79642. "I2": "input",
  79643. "I3": "input",
  79644. "O": "output"
  79645. },
  79646. "connections": {
  79647. "I0": [ "0" ],
  79648. "I1": [ 3708 ],
  79649. "I2": [ 2860 ],
  79650. "I3": [ 3760 ],
  79651. "O": [ 3761 ]
  79652. }
  79653. },
  79654. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O": {
  79655. "hide_name": 0,
  79656. "type": "SB_LUT4",
  79657. "parameters": {
  79658. "LUT_INIT": "1111001111000000"
  79659. },
  79660. "attributes": {
  79661. "module_not_derived": "00000000000000000000000000000001",
  79662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79663. },
  79664. "port_directions": {
  79665. "I0": "input",
  79666. "I1": "input",
  79667. "I2": "input",
  79668. "I3": "input",
  79669. "O": "output"
  79670. },
  79671. "connections": {
  79672. "I0": [ "0" ],
  79673. "I1": [ 3715 ],
  79674. "I2": [ 3234 ],
  79675. "I3": [ 3762 ],
  79676. "O": [ 3760 ]
  79677. }
  79678. },
  79679. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  79680. "hide_name": 0,
  79681. "type": "SB_LUT4",
  79682. "parameters": {
  79683. "LUT_INIT": "1111110000110000"
  79684. },
  79685. "attributes": {
  79686. "module_not_derived": "00000000000000000000000000000001",
  79687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79688. },
  79689. "port_directions": {
  79690. "I0": "input",
  79691. "I1": "input",
  79692. "I2": "input",
  79693. "I3": "input",
  79694. "O": "output"
  79695. },
  79696. "connections": {
  79697. "I0": [ "0" ],
  79698. "I1": [ 2323 ],
  79699. "I2": [ 3763 ],
  79700. "I3": [ 2293 ],
  79701. "O": [ 3762 ]
  79702. }
  79703. },
  79704. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  79705. "hide_name": 0,
  79706. "type": "SB_LUT4",
  79707. "parameters": {
  79708. "LUT_INIT": "1100110011110000"
  79709. },
  79710. "attributes": {
  79711. "module_not_derived": "00000000000000000000000000000001",
  79712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79713. },
  79714. "port_directions": {
  79715. "I0": "input",
  79716. "I1": "input",
  79717. "I2": "input",
  79718. "I3": "input",
  79719. "O": "output"
  79720. },
  79721. "connections": {
  79722. "I0": [ "0" ],
  79723. "I1": [ 2067 ],
  79724. "I2": [ 3764 ],
  79725. "I3": [ 2094 ],
  79726. "O": [ 3763 ]
  79727. }
  79728. },
  79729. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  79730. "hide_name": 0,
  79731. "type": "SB_LUT4",
  79732. "parameters": {
  79733. "LUT_INIT": "1111000011001100"
  79734. },
  79735. "attributes": {
  79736. "module_not_derived": "00000000000000000000000000000001",
  79737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79738. },
  79739. "port_directions": {
  79740. "I0": "input",
  79741. "I1": "input",
  79742. "I2": "input",
  79743. "I3": "input",
  79744. "O": "output"
  79745. },
  79746. "connections": {
  79747. "I0": [ "0" ],
  79748. "I1": [ 2203 ],
  79749. "I2": [ 2114 ],
  79750. "I3": [ 2089 ],
  79751. "O": [ 3764 ]
  79752. }
  79753. },
  79754. "cpu_I.decode_RS1_SB_LUT4_O_22": {
  79755. "hide_name": 0,
  79756. "type": "SB_LUT4",
  79757. "parameters": {
  79758. "LUT_INIT": "1111001111000000"
  79759. },
  79760. "attributes": {
  79761. "module_not_derived": "00000000000000000000000000000001",
  79762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79763. },
  79764. "port_directions": {
  79765. "I0": "input",
  79766. "I1": "input",
  79767. "I2": "input",
  79768. "I3": "input",
  79769. "O": "output"
  79770. },
  79771. "connections": {
  79772. "I0": [ "0" ],
  79773. "I1": [ 3708 ],
  79774. "I2": [ 2922 ],
  79775. "I3": [ 3765 ],
  79776. "O": [ 3766 ]
  79777. }
  79778. },
  79779. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O": {
  79780. "hide_name": 0,
  79781. "type": "SB_LUT4",
  79782. "parameters": {
  79783. "LUT_INIT": "1111001111000000"
  79784. },
  79785. "attributes": {
  79786. "module_not_derived": "00000000000000000000000000000001",
  79787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79788. },
  79789. "port_directions": {
  79790. "I0": "input",
  79791. "I1": "input",
  79792. "I2": "input",
  79793. "I3": "input",
  79794. "O": "output"
  79795. },
  79796. "connections": {
  79797. "I0": [ "0" ],
  79798. "I1": [ 3715 ],
  79799. "I2": [ 3118 ],
  79800. "I3": [ 3767 ],
  79801. "O": [ 3765 ]
  79802. }
  79803. },
  79804. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  79805. "hide_name": 0,
  79806. "type": "SB_LUT4",
  79807. "parameters": {
  79808. "LUT_INIT": "1111110000110000"
  79809. },
  79810. "attributes": {
  79811. "module_not_derived": "00000000000000000000000000000001",
  79812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79813. },
  79814. "port_directions": {
  79815. "I0": "input",
  79816. "I1": "input",
  79817. "I2": "input",
  79818. "I3": "input",
  79819. "O": "output"
  79820. },
  79821. "connections": {
  79822. "I0": [ "0" ],
  79823. "I1": [ 2323 ],
  79824. "I2": [ 3768 ],
  79825. "I3": [ 2273 ],
  79826. "O": [ 3767 ]
  79827. }
  79828. },
  79829. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  79830. "hide_name": 0,
  79831. "type": "SB_LUT4",
  79832. "parameters": {
  79833. "LUT_INIT": "1100110011110000"
  79834. },
  79835. "attributes": {
  79836. "module_not_derived": "00000000000000000000000000000001",
  79837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79838. },
  79839. "port_directions": {
  79840. "I0": "input",
  79841. "I1": "input",
  79842. "I2": "input",
  79843. "I3": "input",
  79844. "O": "output"
  79845. },
  79846. "connections": {
  79847. "I0": [ "0" ],
  79848. "I1": [ 2152 ],
  79849. "I2": [ 3769 ],
  79850. "I3": [ 2094 ],
  79851. "O": [ 3768 ]
  79852. }
  79853. },
  79854. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  79855. "hide_name": 0,
  79856. "type": "SB_LUT4",
  79857. "parameters": {
  79858. "LUT_INIT": "1111000011001100"
  79859. },
  79860. "attributes": {
  79861. "module_not_derived": "00000000000000000000000000000001",
  79862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79863. },
  79864. "port_directions": {
  79865. "I0": "input",
  79866. "I1": "input",
  79867. "I2": "input",
  79868. "I3": "input",
  79869. "O": "output"
  79870. },
  79871. "connections": {
  79872. "I0": [ "0" ],
  79873. "I1": [ 2236 ],
  79874. "I2": [ 2175 ],
  79875. "I3": [ 2089 ],
  79876. "O": [ 3769 ]
  79877. }
  79878. },
  79879. "cpu_I.decode_RS1_SB_LUT4_O_23": {
  79880. "hide_name": 0,
  79881. "type": "SB_LUT4",
  79882. "parameters": {
  79883. "LUT_INIT": "1111001111000000"
  79884. },
  79885. "attributes": {
  79886. "module_not_derived": "00000000000000000000000000000001",
  79887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79888. },
  79889. "port_directions": {
  79890. "I0": "input",
  79891. "I1": "input",
  79892. "I2": "input",
  79893. "I3": "input",
  79894. "O": "output"
  79895. },
  79896. "connections": {
  79897. "I0": [ "0" ],
  79898. "I1": [ 3708 ],
  79899. "I2": [ 2919 ],
  79900. "I3": [ 3770 ],
  79901. "O": [ 3771 ]
  79902. }
  79903. },
  79904. "cpu_I.decode_RS1_SB_LUT4_O_23_I3_SB_LUT4_O": {
  79905. "hide_name": 0,
  79906. "type": "SB_LUT4",
  79907. "parameters": {
  79908. "LUT_INIT": "1111001111000000"
  79909. },
  79910. "attributes": {
  79911. "module_not_derived": "00000000000000000000000000000001",
  79912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79913. },
  79914. "port_directions": {
  79915. "I0": "input",
  79916. "I1": "input",
  79917. "I2": "input",
  79918. "I3": "input",
  79919. "O": "output"
  79920. },
  79921. "connections": {
  79922. "I0": [ "0" ],
  79923. "I1": [ 3715 ],
  79924. "I2": [ 3111 ],
  79925. "I3": [ 3772 ],
  79926. "O": [ 3770 ]
  79927. }
  79928. },
  79929. "cpu_I.decode_RS1_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  79930. "hide_name": 0,
  79931. "type": "SB_LUT4",
  79932. "parameters": {
  79933. "LUT_INIT": "1111110000110000"
  79934. },
  79935. "attributes": {
  79936. "module_not_derived": "00000000000000000000000000000001",
  79937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79938. },
  79939. "port_directions": {
  79940. "I0": "input",
  79941. "I1": "input",
  79942. "I2": "input",
  79943. "I3": "input",
  79944. "O": "output"
  79945. },
  79946. "connections": {
  79947. "I0": [ "0" ],
  79948. "I1": [ 2323 ],
  79949. "I2": [ 2243 ],
  79950. "I3": [ 2274 ],
  79951. "O": [ 3772 ]
  79952. }
  79953. },
  79954. "cpu_I.decode_RS1_SB_LUT4_O_24": {
  79955. "hide_name": 0,
  79956. "type": "SB_LUT4",
  79957. "parameters": {
  79958. "LUT_INIT": "1111001111000000"
  79959. },
  79960. "attributes": {
  79961. "module_not_derived": "00000000000000000000000000000001",
  79962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79963. },
  79964. "port_directions": {
  79965. "I0": "input",
  79966. "I1": "input",
  79967. "I2": "input",
  79968. "I3": "input",
  79969. "O": "output"
  79970. },
  79971. "connections": {
  79972. "I0": [ "0" ],
  79973. "I1": [ 3708 ],
  79974. "I2": [ 2916 ],
  79975. "I3": [ 3773 ],
  79976. "O": [ 3774 ]
  79977. }
  79978. },
  79979. "cpu_I.decode_RS1_SB_LUT4_O_24_I3_SB_LUT4_O": {
  79980. "hide_name": 0,
  79981. "type": "SB_LUT4",
  79982. "parameters": {
  79983. "LUT_INIT": "1111001111000000"
  79984. },
  79985. "attributes": {
  79986. "module_not_derived": "00000000000000000000000000000001",
  79987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  79988. },
  79989. "port_directions": {
  79990. "I0": "input",
  79991. "I1": "input",
  79992. "I2": "input",
  79993. "I3": "input",
  79994. "O": "output"
  79995. },
  79996. "connections": {
  79997. "I0": [ "0" ],
  79998. "I1": [ 3715 ],
  79999. "I2": [ 3104 ],
  80000. "I3": [ 3775 ],
  80001. "O": [ 3773 ]
  80002. }
  80003. },
  80004. "cpu_I.decode_RS1_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80005. "hide_name": 0,
  80006. "type": "SB_LUT4",
  80007. "parameters": {
  80008. "LUT_INIT": "1111110000110000"
  80009. },
  80010. "attributes": {
  80011. "module_not_derived": "00000000000000000000000000000001",
  80012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80013. },
  80014. "port_directions": {
  80015. "I0": "input",
  80016. "I1": "input",
  80017. "I2": "input",
  80018. "I3": "input",
  80019. "O": "output"
  80020. },
  80021. "connections": {
  80022. "I0": [ "0" ],
  80023. "I1": [ 2323 ],
  80024. "I2": [ 2257 ],
  80025. "I3": [ 2275 ],
  80026. "O": [ 3775 ]
  80027. }
  80028. },
  80029. "cpu_I.decode_RS1_SB_LUT4_O_25": {
  80030. "hide_name": 0,
  80031. "type": "SB_LUT4",
  80032. "parameters": {
  80033. "LUT_INIT": "1111001111000000"
  80034. },
  80035. "attributes": {
  80036. "module_not_derived": "00000000000000000000000000000001",
  80037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80038. },
  80039. "port_directions": {
  80040. "I0": "input",
  80041. "I1": "input",
  80042. "I2": "input",
  80043. "I3": "input",
  80044. "O": "output"
  80045. },
  80046. "connections": {
  80047. "I0": [ "0" ],
  80048. "I1": [ 3708 ],
  80049. "I2": [ 2904 ],
  80050. "I3": [ 3776 ],
  80051. "O": [ 3777 ]
  80052. }
  80053. },
  80054. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O": {
  80055. "hide_name": 0,
  80056. "type": "SB_LUT4",
  80057. "parameters": {
  80058. "LUT_INIT": "1111001111000000"
  80059. },
  80060. "attributes": {
  80061. "module_not_derived": "00000000000000000000000000000001",
  80062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80063. },
  80064. "port_directions": {
  80065. "I0": "input",
  80066. "I1": "input",
  80067. "I2": "input",
  80068. "I3": "input",
  80069. "O": "output"
  80070. },
  80071. "connections": {
  80072. "I0": [ "0" ],
  80073. "I1": [ 3715 ],
  80074. "I2": [ 3099 ],
  80075. "I3": [ 3778 ],
  80076. "O": [ 3776 ]
  80077. }
  80078. },
  80079. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80080. "hide_name": 0,
  80081. "type": "SB_LUT4",
  80082. "parameters": {
  80083. "LUT_INIT": "1111110000110000"
  80084. },
  80085. "attributes": {
  80086. "module_not_derived": "00000000000000000000000000000001",
  80087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80088. },
  80089. "port_directions": {
  80090. "I0": "input",
  80091. "I1": "input",
  80092. "I2": "input",
  80093. "I3": "input",
  80094. "O": "output"
  80095. },
  80096. "connections": {
  80097. "I0": [ "0" ],
  80098. "I1": [ 2323 ],
  80099. "I2": [ 3779 ],
  80100. "I3": [ 2276 ],
  80101. "O": [ 3778 ]
  80102. }
  80103. },
  80104. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  80105. "hide_name": 0,
  80106. "type": "SB_LUT4",
  80107. "parameters": {
  80108. "LUT_INIT": "1100110011110000"
  80109. },
  80110. "attributes": {
  80111. "module_not_derived": "00000000000000000000000000000001",
  80112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80113. },
  80114. "port_directions": {
  80115. "I0": "input",
  80116. "I1": "input",
  80117. "I2": "input",
  80118. "I3": "input",
  80119. "O": "output"
  80120. },
  80121. "connections": {
  80122. "I0": [ "0" ],
  80123. "I1": [ 2140 ],
  80124. "I2": [ 3780 ],
  80125. "I3": [ 2094 ],
  80126. "O": [ 3779 ]
  80127. }
  80128. },
  80129. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  80130. "hide_name": 0,
  80131. "type": "SB_LUT4",
  80132. "parameters": {
  80133. "LUT_INIT": "1111000011001100"
  80134. },
  80135. "attributes": {
  80136. "module_not_derived": "00000000000000000000000000000001",
  80137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80138. },
  80139. "port_directions": {
  80140. "I0": "input",
  80141. "I1": "input",
  80142. "I2": "input",
  80143. "I3": "input",
  80144. "O": "output"
  80145. },
  80146. "connections": {
  80147. "I0": [ "0" ],
  80148. "I1": [ 2224 ],
  80149. "I2": [ 2168 ],
  80150. "I3": [ 2089 ],
  80151. "O": [ 3780 ]
  80152. }
  80153. },
  80154. "cpu_I.decode_RS1_SB_LUT4_O_26": {
  80155. "hide_name": 0,
  80156. "type": "SB_LUT4",
  80157. "parameters": {
  80158. "LUT_INIT": "1111001111000000"
  80159. },
  80160. "attributes": {
  80161. "module_not_derived": "00000000000000000000000000000001",
  80162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80163. },
  80164. "port_directions": {
  80165. "I0": "input",
  80166. "I1": "input",
  80167. "I2": "input",
  80168. "I3": "input",
  80169. "O": "output"
  80170. },
  80171. "connections": {
  80172. "I0": [ "0" ],
  80173. "I1": [ 3708 ],
  80174. "I2": [ 2901 ],
  80175. "I3": [ 3781 ],
  80176. "O": [ 3782 ]
  80177. }
  80178. },
  80179. "cpu_I.decode_RS1_SB_LUT4_O_26_I3_SB_LUT4_O": {
  80180. "hide_name": 0,
  80181. "type": "SB_LUT4",
  80182. "parameters": {
  80183. "LUT_INIT": "0000000011110011"
  80184. },
  80185. "attributes": {
  80186. "module_not_derived": "00000000000000000000000000000001",
  80187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80188. },
  80189. "port_directions": {
  80190. "I0": "input",
  80191. "I1": "input",
  80192. "I2": "input",
  80193. "I3": "input",
  80194. "O": "output"
  80195. },
  80196. "connections": {
  80197. "I0": [ "0" ],
  80198. "I1": [ 3715 ],
  80199. "I2": [ 3088 ],
  80200. "I3": [ 3783 ],
  80201. "O": [ 3781 ]
  80202. }
  80203. },
  80204. "cpu_I.decode_RS1_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80205. "hide_name": 0,
  80206. "type": "SB_LUT4",
  80207. "parameters": {
  80208. "LUT_INIT": "0000000101000101"
  80209. },
  80210. "attributes": {
  80211. "module_not_derived": "00000000000000000000000000000001",
  80212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80213. },
  80214. "port_directions": {
  80215. "I0": "input",
  80216. "I1": "input",
  80217. "I2": "input",
  80218. "I3": "input",
  80219. "O": "output"
  80220. },
  80221. "connections": {
  80222. "I0": [ 3715 ],
  80223. "I1": [ 2323 ],
  80224. "I2": [ 2223 ],
  80225. "I3": [ 2277 ],
  80226. "O": [ 3783 ]
  80227. }
  80228. },
  80229. "cpu_I.decode_RS1_SB_LUT4_O_27": {
  80230. "hide_name": 0,
  80231. "type": "SB_LUT4",
  80232. "parameters": {
  80233. "LUT_INIT": "1111001111000000"
  80234. },
  80235. "attributes": {
  80236. "module_not_derived": "00000000000000000000000000000001",
  80237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80238. },
  80239. "port_directions": {
  80240. "I0": "input",
  80241. "I1": "input",
  80242. "I2": "input",
  80243. "I3": "input",
  80244. "O": "output"
  80245. },
  80246. "connections": {
  80247. "I0": [ "0" ],
  80248. "I1": [ 3708 ],
  80249. "I2": [ 2888 ],
  80250. "I3": [ 3784 ],
  80251. "O": [ 3785 ]
  80252. }
  80253. },
  80254. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O": {
  80255. "hide_name": 0,
  80256. "type": "SB_LUT4",
  80257. "parameters": {
  80258. "LUT_INIT": "0000000011110011"
  80259. },
  80260. "attributes": {
  80261. "module_not_derived": "00000000000000000000000000000001",
  80262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80263. },
  80264. "port_directions": {
  80265. "I0": "input",
  80266. "I1": "input",
  80267. "I2": "input",
  80268. "I3": "input",
  80269. "O": "output"
  80270. },
  80271. "connections": {
  80272. "I0": [ "0" ],
  80273. "I1": [ 3715 ],
  80274. "I2": [ 3271 ],
  80275. "I3": [ 3786 ],
  80276. "O": [ 3784 ]
  80277. }
  80278. },
  80279. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80280. "hide_name": 0,
  80281. "type": "SB_LUT4",
  80282. "parameters": {
  80283. "LUT_INIT": "0000000101000101"
  80284. },
  80285. "attributes": {
  80286. "module_not_derived": "00000000000000000000000000000001",
  80287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80288. },
  80289. "port_directions": {
  80290. "I0": "input",
  80291. "I1": "input",
  80292. "I2": "input",
  80293. "I3": "input",
  80294. "O": "output"
  80295. },
  80296. "connections": {
  80297. "I0": [ 3715 ],
  80298. "I1": [ 2323 ],
  80299. "I2": [ 3787 ],
  80300. "I3": [ 2278 ],
  80301. "O": [ 3786 ]
  80302. }
  80303. },
  80304. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  80305. "hide_name": 0,
  80306. "type": "SB_LUT4",
  80307. "parameters": {
  80308. "LUT_INIT": "1100110011110000"
  80309. },
  80310. "attributes": {
  80311. "module_not_derived": "00000000000000000000000000000001",
  80312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80313. },
  80314. "port_directions": {
  80315. "I0": "input",
  80316. "I1": "input",
  80317. "I2": "input",
  80318. "I3": "input",
  80319. "O": "output"
  80320. },
  80321. "connections": {
  80322. "I0": [ "0" ],
  80323. "I1": [ 2066 ],
  80324. "I2": [ 3788 ],
  80325. "I3": [ 2094 ],
  80326. "O": [ 3787 ]
  80327. }
  80328. },
  80329. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  80330. "hide_name": 0,
  80331. "type": "SB_LUT4",
  80332. "parameters": {
  80333. "LUT_INIT": "1111000011001100"
  80334. },
  80335. "attributes": {
  80336. "module_not_derived": "00000000000000000000000000000001",
  80337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80338. },
  80339. "port_directions": {
  80340. "I0": "input",
  80341. "I1": "input",
  80342. "I2": "input",
  80343. "I3": "input",
  80344. "O": "output"
  80345. },
  80346. "connections": {
  80347. "I0": [ "0" ],
  80348. "I1": [ 2202 ],
  80349. "I2": [ 2117 ],
  80350. "I3": [ 2089 ],
  80351. "O": [ 3788 ]
  80352. }
  80353. },
  80354. "cpu_I.decode_RS1_SB_LUT4_O_28": {
  80355. "hide_name": 0,
  80356. "type": "SB_LUT4",
  80357. "parameters": {
  80358. "LUT_INIT": "1111001111000000"
  80359. },
  80360. "attributes": {
  80361. "module_not_derived": "00000000000000000000000000000001",
  80362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80363. },
  80364. "port_directions": {
  80365. "I0": "input",
  80366. "I1": "input",
  80367. "I2": "input",
  80368. "I3": "input",
  80369. "O": "output"
  80370. },
  80371. "connections": {
  80372. "I0": [ "0" ],
  80373. "I1": [ 3708 ],
  80374. "I2": [ 2885 ],
  80375. "I3": [ 3789 ],
  80376. "O": [ 3790 ]
  80377. }
  80378. },
  80379. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O": {
  80380. "hide_name": 0,
  80381. "type": "SB_LUT4",
  80382. "parameters": {
  80383. "LUT_INIT": "0000000011110011"
  80384. },
  80385. "attributes": {
  80386. "module_not_derived": "00000000000000000000000000000001",
  80387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80388. },
  80389. "port_directions": {
  80390. "I0": "input",
  80391. "I1": "input",
  80392. "I2": "input",
  80393. "I3": "input",
  80394. "O": "output"
  80395. },
  80396. "connections": {
  80397. "I0": [ "0" ],
  80398. "I1": [ 3715 ],
  80399. "I2": [ 3266 ],
  80400. "I3": [ 3791 ],
  80401. "O": [ 3789 ]
  80402. }
  80403. },
  80404. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80405. "hide_name": 0,
  80406. "type": "SB_LUT4",
  80407. "parameters": {
  80408. "LUT_INIT": "0000000101000101"
  80409. },
  80410. "attributes": {
  80411. "module_not_derived": "00000000000000000000000000000001",
  80412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80413. },
  80414. "port_directions": {
  80415. "I0": "input",
  80416. "I1": "input",
  80417. "I2": "input",
  80418. "I3": "input",
  80419. "O": "output"
  80420. },
  80421. "connections": {
  80422. "I0": [ 3715 ],
  80423. "I1": [ 2323 ],
  80424. "I2": [ 3792 ],
  80425. "I3": [ 2279 ],
  80426. "O": [ 3791 ]
  80427. }
  80428. },
  80429. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  80430. "hide_name": 0,
  80431. "type": "SB_LUT4",
  80432. "parameters": {
  80433. "LUT_INIT": "1100110011110000"
  80434. },
  80435. "attributes": {
  80436. "module_not_derived": "00000000000000000000000000000001",
  80437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80438. },
  80439. "port_directions": {
  80440. "I0": "input",
  80441. "I1": "input",
  80442. "I2": "input",
  80443. "I3": "input",
  80444. "O": "output"
  80445. },
  80446. "connections": {
  80447. "I0": [ "0" ],
  80448. "I1": [ 2070 ],
  80449. "I2": [ 3793 ],
  80450. "I3": [ 2094 ],
  80451. "O": [ 3792 ]
  80452. }
  80453. },
  80454. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  80455. "hide_name": 0,
  80456. "type": "SB_LUT4",
  80457. "parameters": {
  80458. "LUT_INIT": "1111000011001100"
  80459. },
  80460. "attributes": {
  80461. "module_not_derived": "00000000000000000000000000000001",
  80462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80463. },
  80464. "port_directions": {
  80465. "I0": "input",
  80466. "I1": "input",
  80467. "I2": "input",
  80468. "I3": "input",
  80469. "O": "output"
  80470. },
  80471. "connections": {
  80472. "I0": [ "0" ],
  80473. "I1": [ 2206 ],
  80474. "I2": [ 2104 ],
  80475. "I3": [ 2089 ],
  80476. "O": [ 3793 ]
  80477. }
  80478. },
  80479. "cpu_I.decode_RS1_SB_LUT4_O_29": {
  80480. "hide_name": 0,
  80481. "type": "SB_LUT4",
  80482. "parameters": {
  80483. "LUT_INIT": "1111001111000000"
  80484. },
  80485. "attributes": {
  80486. "module_not_derived": "00000000000000000000000000000001",
  80487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80488. },
  80489. "port_directions": {
  80490. "I0": "input",
  80491. "I1": "input",
  80492. "I2": "input",
  80493. "I3": "input",
  80494. "O": "output"
  80495. },
  80496. "connections": {
  80497. "I0": [ "0" ],
  80498. "I1": [ 3708 ],
  80499. "I2": [ 2875 ],
  80500. "I3": [ 3794 ],
  80501. "O": [ 3795 ]
  80502. }
  80503. },
  80504. "cpu_I.decode_RS1_SB_LUT4_O_29_I3_SB_LUT4_O": {
  80505. "hide_name": 0,
  80506. "type": "SB_LUT4",
  80507. "parameters": {
  80508. "LUT_INIT": "0000000011110011"
  80509. },
  80510. "attributes": {
  80511. "module_not_derived": "00000000000000000000000000000001",
  80512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80513. },
  80514. "port_directions": {
  80515. "I0": "input",
  80516. "I1": "input",
  80517. "I2": "input",
  80518. "I3": "input",
  80519. "O": "output"
  80520. },
  80521. "connections": {
  80522. "I0": [ "0" ],
  80523. "I1": [ 3715 ],
  80524. "I2": [ 3261 ],
  80525. "I3": [ 3796 ],
  80526. "O": [ 3794 ]
  80527. }
  80528. },
  80529. "cpu_I.decode_RS1_SB_LUT4_O_29_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80530. "hide_name": 0,
  80531. "type": "SB_LUT4",
  80532. "parameters": {
  80533. "LUT_INIT": "0000000101000101"
  80534. },
  80535. "attributes": {
  80536. "module_not_derived": "00000000000000000000000000000001",
  80537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80538. },
  80539. "port_directions": {
  80540. "I0": "input",
  80541. "I1": "input",
  80542. "I2": "input",
  80543. "I3": "input",
  80544. "O": "output"
  80545. },
  80546. "connections": {
  80547. "I0": [ 3715 ],
  80548. "I1": [ 2323 ],
  80549. "I2": [ 2214 ],
  80550. "I3": [ 2280 ],
  80551. "O": [ 3796 ]
  80552. }
  80553. },
  80554. "cpu_I.decode_RS1_SB_LUT4_O_2_I3_SB_LUT4_O": {
  80555. "hide_name": 0,
  80556. "type": "SB_LUT4",
  80557. "parameters": {
  80558. "LUT_INIT": "0000000011110011"
  80559. },
  80560. "attributes": {
  80561. "module_not_derived": "00000000000000000000000000000001",
  80562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80563. },
  80564. "port_directions": {
  80565. "I0": "input",
  80566. "I1": "input",
  80567. "I2": "input",
  80568. "I3": "input",
  80569. "O": "output"
  80570. },
  80571. "connections": {
  80572. "I0": [ "0" ],
  80573. "I1": [ 3715 ],
  80574. "I2": [ 3184 ],
  80575. "I3": [ 3797 ],
  80576. "O": [ 3753 ]
  80577. }
  80578. },
  80579. "cpu_I.decode_RS1_SB_LUT4_O_2_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80580. "hide_name": 0,
  80581. "type": "SB_LUT4",
  80582. "parameters": {
  80583. "LUT_INIT": "0000000101000101"
  80584. },
  80585. "attributes": {
  80586. "module_not_derived": "00000000000000000000000000000001",
  80587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80588. },
  80589. "port_directions": {
  80590. "I0": "input",
  80591. "I1": "input",
  80592. "I2": "input",
  80593. "I3": "input",
  80594. "O": "output"
  80595. },
  80596. "connections": {
  80597. "I0": [ 3715 ],
  80598. "I1": [ 2323 ],
  80599. "I2": [ 2216 ],
  80600. "I3": [ 2285 ],
  80601. "O": [ 3797 ]
  80602. }
  80603. },
  80604. "cpu_I.decode_RS1_SB_LUT4_O_3": {
  80605. "hide_name": 0,
  80606. "type": "SB_LUT4",
  80607. "parameters": {
  80608. "LUT_INIT": "1111001111000000"
  80609. },
  80610. "attributes": {
  80611. "module_not_derived": "00000000000000000000000000000001",
  80612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80613. },
  80614. "port_directions": {
  80615. "I0": "input",
  80616. "I1": "input",
  80617. "I2": "input",
  80618. "I3": "input",
  80619. "O": "output"
  80620. },
  80621. "connections": {
  80622. "I0": [ "0" ],
  80623. "I1": [ 3708 ],
  80624. "I2": [ 3038 ],
  80625. "I3": [ 3798 ],
  80626. "O": [ 3799 ]
  80627. }
  80628. },
  80629. "cpu_I.decode_RS1_SB_LUT4_O_30": {
  80630. "hide_name": 0,
  80631. "type": "SB_LUT4",
  80632. "parameters": {
  80633. "LUT_INIT": "1111001111000000"
  80634. },
  80635. "attributes": {
  80636. "module_not_derived": "00000000000000000000000000000001",
  80637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80638. },
  80639. "port_directions": {
  80640. "I0": "input",
  80641. "I1": "input",
  80642. "I2": "input",
  80643. "I3": "input",
  80644. "O": "output"
  80645. },
  80646. "connections": {
  80647. "I0": [ "0" ],
  80648. "I1": [ 3708 ],
  80649. "I2": [ 2863 ],
  80650. "I3": [ 3800 ],
  80651. "O": [ 3801 ]
  80652. }
  80653. },
  80654. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O": {
  80655. "hide_name": 0,
  80656. "type": "SB_LUT4",
  80657. "parameters": {
  80658. "LUT_INIT": "0000000011110011"
  80659. },
  80660. "attributes": {
  80661. "module_not_derived": "00000000000000000000000000000001",
  80662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80663. },
  80664. "port_directions": {
  80665. "I0": "input",
  80666. "I1": "input",
  80667. "I2": "input",
  80668. "I3": "input",
  80669. "O": "output"
  80670. },
  80671. "connections": {
  80672. "I0": [ "0" ],
  80673. "I1": [ 3715 ],
  80674. "I2": [ 3256 ],
  80675. "I3": [ 3802 ],
  80676. "O": [ 3800 ]
  80677. }
  80678. },
  80679. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80680. "hide_name": 0,
  80681. "type": "SB_LUT4",
  80682. "parameters": {
  80683. "LUT_INIT": "0000000101000101"
  80684. },
  80685. "attributes": {
  80686. "module_not_derived": "00000000000000000000000000000001",
  80687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80688. },
  80689. "port_directions": {
  80690. "I0": "input",
  80691. "I1": "input",
  80692. "I2": "input",
  80693. "I3": "input",
  80694. "O": "output"
  80695. },
  80696. "connections": {
  80697. "I0": [ 3715 ],
  80698. "I1": [ 2323 ],
  80699. "I2": [ 3803 ],
  80700. "I3": [ 2282 ],
  80701. "O": [ 3802 ]
  80702. }
  80703. },
  80704. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  80705. "hide_name": 0,
  80706. "type": "SB_LUT4",
  80707. "parameters": {
  80708. "LUT_INIT": "1100110011110000"
  80709. },
  80710. "attributes": {
  80711. "module_not_derived": "00000000000000000000000000000001",
  80712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80713. },
  80714. "port_directions": {
  80715. "I0": "input",
  80716. "I1": "input",
  80717. "I2": "input",
  80718. "I3": "input",
  80719. "O": "output"
  80720. },
  80721. "connections": {
  80722. "I0": [ "0" ],
  80723. "I1": [ 2072 ],
  80724. "I2": [ 3804 ],
  80725. "I3": [ 2094 ],
  80726. "O": [ 3803 ]
  80727. }
  80728. },
  80729. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  80730. "hide_name": 0,
  80731. "type": "SB_LUT4",
  80732. "parameters": {
  80733. "LUT_INIT": "1111000011001100"
  80734. },
  80735. "attributes": {
  80736. "module_not_derived": "00000000000000000000000000000001",
  80737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80738. },
  80739. "port_directions": {
  80740. "I0": "input",
  80741. "I1": "input",
  80742. "I2": "input",
  80743. "I3": "input",
  80744. "O": "output"
  80745. },
  80746. "connections": {
  80747. "I0": [ "0" ],
  80748. "I1": [ 2208 ],
  80749. "I2": [ 2098 ],
  80750. "I3": [ 2089 ],
  80751. "O": [ 3804 ]
  80752. }
  80753. },
  80754. "cpu_I.decode_RS1_SB_LUT4_O_31": {
  80755. "hide_name": 0,
  80756. "type": "SB_LUT4",
  80757. "parameters": {
  80758. "LUT_INIT": "1111001111000000"
  80759. },
  80760. "attributes": {
  80761. "module_not_derived": "00000000000000000000000000000001",
  80762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80763. },
  80764. "port_directions": {
  80765. "I0": "input",
  80766. "I1": "input",
  80767. "I2": "input",
  80768. "I3": "input",
  80769. "O": "output"
  80770. },
  80771. "connections": {
  80772. "I0": [ "0" ],
  80773. "I1": [ 3708 ],
  80774. "I2": [ 3067 ],
  80775. "I3": [ 3805 ],
  80776. "O": [ 3806 ]
  80777. }
  80778. },
  80779. "cpu_I.decode_RS1_SB_LUT4_O_31_I3_SB_LUT4_O": {
  80780. "hide_name": 0,
  80781. "type": "SB_LUT4",
  80782. "parameters": {
  80783. "LUT_INIT": "0000000011110011"
  80784. },
  80785. "attributes": {
  80786. "module_not_derived": "00000000000000000000000000000001",
  80787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80788. },
  80789. "port_directions": {
  80790. "I0": "input",
  80791. "I1": "input",
  80792. "I2": "input",
  80793. "I3": "input",
  80794. "O": "output"
  80795. },
  80796. "connections": {
  80797. "I0": [ "0" ],
  80798. "I1": [ 3715 ],
  80799. "I2": [ 3239 ],
  80800. "I3": [ 3807 ],
  80801. "O": [ 3805 ]
  80802. }
  80803. },
  80804. "cpu_I.decode_RS1_SB_LUT4_O_31_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80805. "hide_name": 0,
  80806. "type": "SB_LUT4",
  80807. "parameters": {
  80808. "LUT_INIT": "0000000101000101"
  80809. },
  80810. "attributes": {
  80811. "module_not_derived": "00000000000000000000000000000001",
  80812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  80813. },
  80814. "port_directions": {
  80815. "I0": "input",
  80816. "I1": "input",
  80817. "I2": "input",
  80818. "I3": "input",
  80819. "O": "output"
  80820. },
  80821. "connections": {
  80822. "I0": [ 3715 ],
  80823. "I1": [ 2323 ],
  80824. "I2": [ 2212 ],
  80825. "I3": [ 2283 ],
  80826. "O": [ 3807 ]
  80827. }
  80828. },
  80829. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O": {
  80830. "hide_name": 0,
  80831. "type": "SB_LUT4",
  80832. "parameters": {
  80833. "LUT_INIT": "1111001111000000"
  80834. },
  80835. "attributes": {
  80836. "module_not_derived": "00000000000000000000000000000001",
  80837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80838. },
  80839. "port_directions": {
  80840. "I0": "input",
  80841. "I1": "input",
  80842. "I2": "input",
  80843. "I3": "input",
  80844. "O": "output"
  80845. },
  80846. "connections": {
  80847. "I0": [ "0" ],
  80848. "I1": [ 3715 ],
  80849. "I2": [ 3246 ],
  80850. "I3": [ 3808 ],
  80851. "O": [ 3798 ]
  80852. }
  80853. },
  80854. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80855. "hide_name": 0,
  80856. "type": "SB_LUT4",
  80857. "parameters": {
  80858. "LUT_INIT": "1111110000110000"
  80859. },
  80860. "attributes": {
  80861. "module_not_derived": "00000000000000000000000000000001",
  80862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80863. },
  80864. "port_directions": {
  80865. "I0": "input",
  80866. "I1": "input",
  80867. "I2": "input",
  80868. "I3": "input",
  80869. "O": "output"
  80870. },
  80871. "connections": {
  80872. "I0": [ "0" ],
  80873. "I1": [ 2323 ],
  80874. "I2": [ 3809 ],
  80875. "I3": [ 2286 ],
  80876. "O": [ 3808 ]
  80877. }
  80878. },
  80879. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  80880. "hide_name": 0,
  80881. "type": "SB_LUT4",
  80882. "parameters": {
  80883. "LUT_INIT": "1100110011110000"
  80884. },
  80885. "attributes": {
  80886. "module_not_derived": "00000000000000000000000000000001",
  80887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80888. },
  80889. "port_directions": {
  80890. "I0": "input",
  80891. "I1": "input",
  80892. "I2": "input",
  80893. "I3": "input",
  80894. "O": "output"
  80895. },
  80896. "connections": {
  80897. "I0": [ "0" ],
  80898. "I1": [ 2073 ],
  80899. "I2": [ 3810 ],
  80900. "I3": [ 2094 ],
  80901. "O": [ 3809 ]
  80902. }
  80903. },
  80904. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  80905. "hide_name": 0,
  80906. "type": "SB_LUT4",
  80907. "parameters": {
  80908. "LUT_INIT": "1111000011001100"
  80909. },
  80910. "attributes": {
  80911. "module_not_derived": "00000000000000000000000000000001",
  80912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80913. },
  80914. "port_directions": {
  80915. "I0": "input",
  80916. "I1": "input",
  80917. "I2": "input",
  80918. "I3": "input",
  80919. "O": "output"
  80920. },
  80921. "connections": {
  80922. "I0": [ "0" ],
  80923. "I1": [ 2209 ],
  80924. "I2": [ 2095 ],
  80925. "I3": [ 2089 ],
  80926. "O": [ 3810 ]
  80927. }
  80928. },
  80929. "cpu_I.decode_RS1_SB_LUT4_O_4": {
  80930. "hide_name": 0,
  80931. "type": "SB_LUT4",
  80932. "parameters": {
  80933. "LUT_INIT": "1111001111000000"
  80934. },
  80935. "attributes": {
  80936. "module_not_derived": "00000000000000000000000000000001",
  80937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80938. },
  80939. "port_directions": {
  80940. "I0": "input",
  80941. "I1": "input",
  80942. "I2": "input",
  80943. "I3": "input",
  80944. "O": "output"
  80945. },
  80946. "connections": {
  80947. "I0": [ "0" ],
  80948. "I1": [ 3708 ],
  80949. "I2": [ 3025 ],
  80950. "I3": [ 3811 ],
  80951. "O": [ 3812 ]
  80952. }
  80953. },
  80954. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O": {
  80955. "hide_name": 0,
  80956. "type": "SB_LUT4",
  80957. "parameters": {
  80958. "LUT_INIT": "1111001111000000"
  80959. },
  80960. "attributes": {
  80961. "module_not_derived": "00000000000000000000000000000001",
  80962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80963. },
  80964. "port_directions": {
  80965. "I0": "input",
  80966. "I1": "input",
  80967. "I2": "input",
  80968. "I3": "input",
  80969. "O": "output"
  80970. },
  80971. "connections": {
  80972. "I0": [ "0" ],
  80973. "I1": [ 3715 ],
  80974. "I2": [ 3231 ],
  80975. "I3": [ 3813 ],
  80976. "O": [ 3811 ]
  80977. }
  80978. },
  80979. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  80980. "hide_name": 0,
  80981. "type": "SB_LUT4",
  80982. "parameters": {
  80983. "LUT_INIT": "1111110000110000"
  80984. },
  80985. "attributes": {
  80986. "module_not_derived": "00000000000000000000000000000001",
  80987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  80988. },
  80989. "port_directions": {
  80990. "I0": "input",
  80991. "I1": "input",
  80992. "I2": "input",
  80993. "I3": "input",
  80994. "O": "output"
  80995. },
  80996. "connections": {
  80997. "I0": [ "0" ],
  80998. "I1": [ 2323 ],
  80999. "I2": [ 3814 ],
  81000. "I3": [ 2287 ],
  81001. "O": [ 3813 ]
  81002. }
  81003. },
  81004. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81005. "hide_name": 0,
  81006. "type": "SB_LUT4",
  81007. "parameters": {
  81008. "LUT_INIT": "1100110000001111"
  81009. },
  81010. "attributes": {
  81011. "module_not_derived": "00000000000000000000000000000001",
  81012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81013. },
  81014. "port_directions": {
  81015. "I0": "input",
  81016. "I1": "input",
  81017. "I2": "input",
  81018. "I3": "input",
  81019. "O": "output"
  81020. },
  81021. "connections": {
  81022. "I0": [ "0" ],
  81023. "I1": [ 2065 ],
  81024. "I2": [ 3815 ],
  81025. "I3": [ 2094 ],
  81026. "O": [ 3814 ]
  81027. }
  81028. },
  81029. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  81030. "hide_name": 0,
  81031. "type": "SB_LUT4",
  81032. "parameters": {
  81033. "LUT_INIT": "0000111100110011"
  81034. },
  81035. "attributes": {
  81036. "module_not_derived": "00000000000000000000000000000001",
  81037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81038. },
  81039. "port_directions": {
  81040. "I0": "input",
  81041. "I1": "input",
  81042. "I2": "input",
  81043. "I3": "input",
  81044. "O": "output"
  81045. },
  81046. "connections": {
  81047. "I0": [ "0" ],
  81048. "I1": [ 2201 ],
  81049. "I2": [ 2120 ],
  81050. "I3": [ 2089 ],
  81051. "O": [ 3815 ]
  81052. }
  81053. },
  81054. "cpu_I.decode_RS1_SB_LUT4_O_5": {
  81055. "hide_name": 0,
  81056. "type": "SB_LUT4",
  81057. "parameters": {
  81058. "LUT_INIT": "1111001111000000"
  81059. },
  81060. "attributes": {
  81061. "module_not_derived": "00000000000000000000000000000001",
  81062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81063. },
  81064. "port_directions": {
  81065. "I0": "input",
  81066. "I1": "input",
  81067. "I2": "input",
  81068. "I3": "input",
  81069. "O": "output"
  81070. },
  81071. "connections": {
  81072. "I0": [ "0" ],
  81073. "I1": [ 3708 ],
  81074. "I2": [ 3003 ],
  81075. "I3": [ 3816 ],
  81076. "O": [ 3817 ]
  81077. }
  81078. },
  81079. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O": {
  81080. "hide_name": 0,
  81081. "type": "SB_LUT4",
  81082. "parameters": {
  81083. "LUT_INIT": "1111001111000000"
  81084. },
  81085. "attributes": {
  81086. "module_not_derived": "00000000000000000000000000000001",
  81087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81088. },
  81089. "port_directions": {
  81090. "I0": "input",
  81091. "I1": "input",
  81092. "I2": "input",
  81093. "I3": "input",
  81094. "O": "output"
  81095. },
  81096. "connections": {
  81097. "I0": [ "0" ],
  81098. "I1": [ 3715 ],
  81099. "I2": [ 3164 ],
  81100. "I3": [ 3818 ],
  81101. "O": [ 3816 ]
  81102. }
  81103. },
  81104. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  81105. "hide_name": 0,
  81106. "type": "SB_LUT4",
  81107. "parameters": {
  81108. "LUT_INIT": "1111110000110000"
  81109. },
  81110. "attributes": {
  81111. "module_not_derived": "00000000000000000000000000000001",
  81112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81113. },
  81114. "port_directions": {
  81115. "I0": "input",
  81116. "I1": "input",
  81117. "I2": "input",
  81118. "I3": "input",
  81119. "O": "output"
  81120. },
  81121. "connections": {
  81122. "I0": [ "0" ],
  81123. "I1": [ 2323 ],
  81124. "I2": [ 3819 ],
  81125. "I3": [ 2288 ],
  81126. "O": [ 3818 ]
  81127. }
  81128. },
  81129. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81130. "hide_name": 0,
  81131. "type": "SB_LUT4",
  81132. "parameters": {
  81133. "LUT_INIT": "1100110000001111"
  81134. },
  81135. "attributes": {
  81136. "module_not_derived": "00000000000000000000000000000001",
  81137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81138. },
  81139. "port_directions": {
  81140. "I0": "input",
  81141. "I1": "input",
  81142. "I2": "input",
  81143. "I3": "input",
  81144. "O": "output"
  81145. },
  81146. "connections": {
  81147. "I0": [ "0" ],
  81148. "I1": [ 2069 ],
  81149. "I2": [ 3820 ],
  81150. "I3": [ 2094 ],
  81151. "O": [ 3819 ]
  81152. }
  81153. },
  81154. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  81155. "hide_name": 0,
  81156. "type": "SB_LUT4",
  81157. "parameters": {
  81158. "LUT_INIT": "0000111100110011"
  81159. },
  81160. "attributes": {
  81161. "module_not_derived": "00000000000000000000000000000001",
  81162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81163. },
  81164. "port_directions": {
  81165. "I0": "input",
  81166. "I1": "input",
  81167. "I2": "input",
  81168. "I3": "input",
  81169. "O": "output"
  81170. },
  81171. "connections": {
  81172. "I0": [ "0" ],
  81173. "I1": [ 2205 ],
  81174. "I2": [ 2107 ],
  81175. "I3": [ 2089 ],
  81176. "O": [ 3820 ]
  81177. }
  81178. },
  81179. "cpu_I.decode_RS1_SB_LUT4_O_6": {
  81180. "hide_name": 0,
  81181. "type": "SB_LUT4",
  81182. "parameters": {
  81183. "LUT_INIT": "1111001111000000"
  81184. },
  81185. "attributes": {
  81186. "module_not_derived": "00000000000000000000000000000001",
  81187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81188. },
  81189. "port_directions": {
  81190. "I0": "input",
  81191. "I1": "input",
  81192. "I2": "input",
  81193. "I3": "input",
  81194. "O": "output"
  81195. },
  81196. "connections": {
  81197. "I0": [ "0" ],
  81198. "I1": [ 3708 ],
  81199. "I2": [ 2976 ],
  81200. "I3": [ 3821 ],
  81201. "O": [ 3822 ]
  81202. }
  81203. },
  81204. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O": {
  81205. "hide_name": 0,
  81206. "type": "SB_LUT4",
  81207. "parameters": {
  81208. "LUT_INIT": "1111001111000000"
  81209. },
  81210. "attributes": {
  81211. "module_not_derived": "00000000000000000000000000000001",
  81212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81213. },
  81214. "port_directions": {
  81215. "I0": "input",
  81216. "I1": "input",
  81217. "I2": "input",
  81218. "I3": "input",
  81219. "O": "output"
  81220. },
  81221. "connections": {
  81222. "I0": [ "0" ],
  81223. "I1": [ 3715 ],
  81224. "I2": [ 3085 ],
  81225. "I3": [ 3823 ],
  81226. "O": [ 3821 ]
  81227. }
  81228. },
  81229. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  81230. "hide_name": 0,
  81231. "type": "SB_LUT4",
  81232. "parameters": {
  81233. "LUT_INIT": "1100111111000000"
  81234. },
  81235. "attributes": {
  81236. "module_not_derived": "00000000000000000000000000000001",
  81237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81238. },
  81239. "port_directions": {
  81240. "I0": "input",
  81241. "I1": "input",
  81242. "I2": "input",
  81243. "I3": "input",
  81244. "O": "output"
  81245. },
  81246. "connections": {
  81247. "I0": [ "0" ],
  81248. "I1": [ 2289 ],
  81249. "I2": [ 2323 ],
  81250. "I3": [ 3824 ],
  81251. "O": [ 3823 ]
  81252. }
  81253. },
  81254. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  81255. "hide_name": 0,
  81256. "type": "SB_LUT4",
  81257. "parameters": {
  81258. "LUT_INIT": "1100110000001111"
  81259. },
  81260. "attributes": {
  81261. "module_not_derived": "00000000000000000000000000000001",
  81262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81263. },
  81264. "port_directions": {
  81265. "I0": "input",
  81266. "I1": "input",
  81267. "I2": "input",
  81268. "I3": "input",
  81269. "O": "output"
  81270. },
  81271. "connections": {
  81272. "I0": [ "0" ],
  81273. "I1": [ 2061 ],
  81274. "I2": [ 3825 ],
  81275. "I3": [ 2094 ],
  81276. "O": [ 3824 ]
  81277. }
  81278. },
  81279. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81280. "hide_name": 0,
  81281. "type": "SB_LUT4",
  81282. "parameters": {
  81283. "LUT_INIT": "0000111100110011"
  81284. },
  81285. "attributes": {
  81286. "module_not_derived": "00000000000000000000000000000001",
  81287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81288. },
  81289. "port_directions": {
  81290. "I0": "input",
  81291. "I1": "input",
  81292. "I2": "input",
  81293. "I3": "input",
  81294. "O": "output"
  81295. },
  81296. "connections": {
  81297. "I0": [ "0" ],
  81298. "I1": [ 2197 ],
  81299. "I2": [ 2083 ],
  81300. "I3": [ 2089 ],
  81301. "O": [ 3825 ]
  81302. }
  81303. },
  81304. "cpu_I.decode_RS1_SB_LUT4_O_7": {
  81305. "hide_name": 0,
  81306. "type": "SB_LUT4",
  81307. "parameters": {
  81308. "LUT_INIT": "1111001111000000"
  81309. },
  81310. "attributes": {
  81311. "module_not_derived": "00000000000000000000000000000001",
  81312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81313. },
  81314. "port_directions": {
  81315. "I0": "input",
  81316. "I1": "input",
  81317. "I2": "input",
  81318. "I3": "input",
  81319. "O": "output"
  81320. },
  81321. "connections": {
  81322. "I0": [ "0" ],
  81323. "I1": [ 3708 ],
  81324. "I2": [ 2936 ],
  81325. "I3": [ 3826 ],
  81326. "O": [ 3827 ]
  81327. }
  81328. },
  81329. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O": {
  81330. "hide_name": 0,
  81331. "type": "SB_LUT4",
  81332. "parameters": {
  81333. "LUT_INIT": "1111001111000000"
  81334. },
  81335. "attributes": {
  81336. "module_not_derived": "00000000000000000000000000000001",
  81337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81338. },
  81339. "port_directions": {
  81340. "I0": "input",
  81341. "I1": "input",
  81342. "I2": "input",
  81343. "I3": "input",
  81344. "O": "output"
  81345. },
  81346. "connections": {
  81347. "I0": [ "0" ],
  81348. "I1": [ 3715 ],
  81349. "I2": [ 3082 ],
  81350. "I3": [ 3828 ],
  81351. "O": [ 3826 ]
  81352. }
  81353. },
  81354. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  81355. "hide_name": 0,
  81356. "type": "SB_LUT4",
  81357. "parameters": {
  81358. "LUT_INIT": "1100111111000000"
  81359. },
  81360. "attributes": {
  81361. "module_not_derived": "00000000000000000000000000000001",
  81362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81363. },
  81364. "port_directions": {
  81365. "I0": "input",
  81366. "I1": "input",
  81367. "I2": "input",
  81368. "I3": "input",
  81369. "O": "output"
  81370. },
  81371. "connections": {
  81372. "I0": [ "0" ],
  81373. "I1": [ 2290 ],
  81374. "I2": [ 2323 ],
  81375. "I3": [ 3829 ],
  81376. "O": [ 3828 ]
  81377. }
  81378. },
  81379. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  81380. "hide_name": 0,
  81381. "type": "SB_LUT4",
  81382. "parameters": {
  81383. "LUT_INIT": "1100110000001111"
  81384. },
  81385. "attributes": {
  81386. "module_not_derived": "00000000000000000000000000000001",
  81387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81388. },
  81389. "port_directions": {
  81390. "I0": "input",
  81391. "I1": "input",
  81392. "I2": "input",
  81393. "I3": "input",
  81394. "O": "output"
  81395. },
  81396. "connections": {
  81397. "I0": [ "0" ],
  81398. "I1": [ 2071 ],
  81399. "I2": [ 3830 ],
  81400. "I3": [ 2094 ],
  81401. "O": [ 3829 ]
  81402. }
  81403. },
  81404. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81405. "hide_name": 0,
  81406. "type": "SB_LUT4",
  81407. "parameters": {
  81408. "LUT_INIT": "0000111100110011"
  81409. },
  81410. "attributes": {
  81411. "module_not_derived": "00000000000000000000000000000001",
  81412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81413. },
  81414. "port_directions": {
  81415. "I0": "input",
  81416. "I1": "input",
  81417. "I2": "input",
  81418. "I3": "input",
  81419. "O": "output"
  81420. },
  81421. "connections": {
  81422. "I0": [ "0" ],
  81423. "I1": [ 2207 ],
  81424. "I2": [ 2101 ],
  81425. "I3": [ 2089 ],
  81426. "O": [ 3830 ]
  81427. }
  81428. },
  81429. "cpu_I.decode_RS1_SB_LUT4_O_8": {
  81430. "hide_name": 0,
  81431. "type": "SB_LUT4",
  81432. "parameters": {
  81433. "LUT_INIT": "1111110000110000"
  81434. },
  81435. "attributes": {
  81436. "module_not_derived": "00000000000000000000000000000001",
  81437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81438. },
  81439. "port_directions": {
  81440. "I0": "input",
  81441. "I1": "input",
  81442. "I2": "input",
  81443. "I3": "input",
  81444. "O": "output"
  81445. },
  81446. "connections": {
  81447. "I0": [ "0" ],
  81448. "I1": [ 3708 ],
  81449. "I2": [ 3831 ],
  81450. "I3": [ 2971 ],
  81451. "O": [ 3832 ]
  81452. }
  81453. },
  81454. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O": {
  81455. "hide_name": 0,
  81456. "type": "SB_LUT4",
  81457. "parameters": {
  81458. "LUT_INIT": "0000000011110011"
  81459. },
  81460. "attributes": {
  81461. "module_not_derived": "00000000000000000000000000000001",
  81462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81463. },
  81464. "port_directions": {
  81465. "I0": "input",
  81466. "I1": "input",
  81467. "I2": "input",
  81468. "I3": "input",
  81469. "O": "output"
  81470. },
  81471. "connections": {
  81472. "I0": [ "0" ],
  81473. "I1": [ 3715 ],
  81474. "I2": [ 3172 ],
  81475. "I3": [ 3833 ],
  81476. "O": [ 3831 ]
  81477. }
  81478. },
  81479. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  81480. "hide_name": 0,
  81481. "type": "SB_LUT4",
  81482. "parameters": {
  81483. "LUT_INIT": "0000000101000101"
  81484. },
  81485. "attributes": {
  81486. "module_not_derived": "00000000000000000000000000000001",
  81487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  81488. },
  81489. "port_directions": {
  81490. "I0": "input",
  81491. "I1": "input",
  81492. "I2": "input",
  81493. "I3": "input",
  81494. "O": "output"
  81495. },
  81496. "connections": {
  81497. "I0": [ 3715 ],
  81498. "I1": [ 2323 ],
  81499. "I2": [ 3834 ],
  81500. "I3": [ 2269 ],
  81501. "O": [ 3833 ]
  81502. }
  81503. },
  81504. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81505. "hide_name": 0,
  81506. "type": "SB_LUT4",
  81507. "parameters": {
  81508. "LUT_INIT": "1100110011110000"
  81509. },
  81510. "attributes": {
  81511. "module_not_derived": "00000000000000000000000000000001",
  81512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81513. },
  81514. "port_directions": {
  81515. "I0": "input",
  81516. "I1": "input",
  81517. "I2": "input",
  81518. "I3": "input",
  81519. "O": "output"
  81520. },
  81521. "connections": {
  81522. "I0": [ "0" ],
  81523. "I1": [ 2155 ],
  81524. "I2": [ 3835 ],
  81525. "I3": [ 2094 ],
  81526. "O": [ 3834 ]
  81527. }
  81528. },
  81529. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  81530. "hide_name": 0,
  81531. "type": "SB_LUT4",
  81532. "parameters": {
  81533. "LUT_INIT": "1111000011001100"
  81534. },
  81535. "attributes": {
  81536. "module_not_derived": "00000000000000000000000000000001",
  81537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81538. },
  81539. "port_directions": {
  81540. "I0": "input",
  81541. "I1": "input",
  81542. "I2": "input",
  81543. "I3": "input",
  81544. "O": "output"
  81545. },
  81546. "connections": {
  81547. "I0": [ "0" ],
  81548. "I1": [ 2239 ],
  81549. "I2": [ 2188 ],
  81550. "I3": [ 2089 ],
  81551. "O": [ 3835 ]
  81552. }
  81553. },
  81554. "cpu_I.decode_RS1_SB_LUT4_O_9": {
  81555. "hide_name": 0,
  81556. "type": "SB_LUT4",
  81557. "parameters": {
  81558. "LUT_INIT": "1111110000110000"
  81559. },
  81560. "attributes": {
  81561. "module_not_derived": "00000000000000000000000000000001",
  81562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81563. },
  81564. "port_directions": {
  81565. "I0": "input",
  81566. "I1": "input",
  81567. "I2": "input",
  81568. "I3": "input",
  81569. "O": "output"
  81570. },
  81571. "connections": {
  81572. "I0": [ "0" ],
  81573. "I1": [ 3708 ],
  81574. "I2": [ 3836 ],
  81575. "I3": [ 2969 ],
  81576. "O": [ 3837 ]
  81577. }
  81578. },
  81579. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O": {
  81580. "hide_name": 0,
  81581. "type": "SB_LUT4",
  81582. "parameters": {
  81583. "LUT_INIT": "1111001111000000"
  81584. },
  81585. "attributes": {
  81586. "module_not_derived": "00000000000000000000000000000001",
  81587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81588. },
  81589. "port_directions": {
  81590. "I0": "input",
  81591. "I1": "input",
  81592. "I2": "input",
  81593. "I3": "input",
  81594. "O": "output"
  81595. },
  81596. "connections": {
  81597. "I0": [ "0" ],
  81598. "I1": [ 3715 ],
  81599. "I2": [ 3189 ],
  81600. "I3": [ 3838 ],
  81601. "O": [ 3836 ]
  81602. }
  81603. },
  81604. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  81605. "hide_name": 0,
  81606. "type": "SB_LUT4",
  81607. "parameters": {
  81608. "LUT_INIT": "1111110000110000"
  81609. },
  81610. "attributes": {
  81611. "module_not_derived": "00000000000000000000000000000001",
  81612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81613. },
  81614. "port_directions": {
  81615. "I0": "input",
  81616. "I1": "input",
  81617. "I2": "input",
  81618. "I3": "input",
  81619. "O": "output"
  81620. },
  81621. "connections": {
  81622. "I0": [ "0" ],
  81623. "I1": [ 2323 ],
  81624. "I2": [ 3839 ],
  81625. "I3": [ 2270 ],
  81626. "O": [ 3838 ]
  81627. }
  81628. },
  81629. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81630. "hide_name": 0,
  81631. "type": "SB_LUT4",
  81632. "parameters": {
  81633. "LUT_INIT": "1100110011110000"
  81634. },
  81635. "attributes": {
  81636. "module_not_derived": "00000000000000000000000000000001",
  81637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81638. },
  81639. "port_directions": {
  81640. "I0": "input",
  81641. "I1": "input",
  81642. "I2": "input",
  81643. "I3": "input",
  81644. "O": "output"
  81645. },
  81646. "connections": {
  81647. "I0": [ "0" ],
  81648. "I1": [ 2147 ],
  81649. "I2": [ 3840 ],
  81650. "I3": [ 2094 ],
  81651. "O": [ 3839 ]
  81652. }
  81653. },
  81654. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  81655. "hide_name": 0,
  81656. "type": "SB_LUT4",
  81657. "parameters": {
  81658. "LUT_INIT": "1111000011001100"
  81659. },
  81660. "attributes": {
  81661. "module_not_derived": "00000000000000000000000000000001",
  81662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81663. },
  81664. "port_directions": {
  81665. "I0": "input",
  81666. "I1": "input",
  81667. "I2": "input",
  81668. "I3": "input",
  81669. "O": "output"
  81670. },
  81671. "connections": {
  81672. "I0": [ "0" ],
  81673. "I1": [ 2231 ],
  81674. "I2": [ 2182 ],
  81675. "I3": [ 2089 ],
  81676. "O": [ 3840 ]
  81677. }
  81678. },
  81679. "cpu_I.decode_RS2_SB_LUT4_O": {
  81680. "hide_name": 0,
  81681. "type": "SB_LUT4",
  81682. "parameters": {
  81683. "LUT_INIT": "1100111100000011"
  81684. },
  81685. "attributes": {
  81686. "module_not_derived": "00000000000000000000000000000001",
  81687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81688. },
  81689. "port_directions": {
  81690. "I0": "input",
  81691. "I1": "input",
  81692. "I2": "input",
  81693. "I3": "input",
  81694. "O": "output"
  81695. },
  81696. "connections": {
  81697. "I0": [ "0" ],
  81698. "I1": [ 3841 ],
  81699. "I2": [ 3842 ],
  81700. "I3": [ 2970 ],
  81701. "O": [ 3843 ]
  81702. }
  81703. },
  81704. "cpu_I.decode_RS2_SB_LUT4_O_1": {
  81705. "hide_name": 0,
  81706. "type": "SB_LUT4",
  81707. "parameters": {
  81708. "LUT_INIT": "1111001111000000"
  81709. },
  81710. "attributes": {
  81711. "module_not_derived": "00000000000000000000000000000001",
  81712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81713. },
  81714. "port_directions": {
  81715. "I0": "input",
  81716. "I1": "input",
  81717. "I2": "input",
  81718. "I3": "input",
  81719. "O": "output"
  81720. },
  81721. "connections": {
  81722. "I0": [ "0" ],
  81723. "I1": [ 3841 ],
  81724. "I2": [ 3064 ],
  81725. "I3": [ 3844 ],
  81726. "O": [ 3845 ]
  81727. }
  81728. },
  81729. "cpu_I.decode_RS2_SB_LUT4_O_10": {
  81730. "hide_name": 0,
  81731. "type": "SB_LUT4",
  81732. "parameters": {
  81733. "LUT_INIT": "1111001111000000"
  81734. },
  81735. "attributes": {
  81736. "module_not_derived": "00000000000000000000000000000001",
  81737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81738. },
  81739. "port_directions": {
  81740. "I0": "input",
  81741. "I1": "input",
  81742. "I2": "input",
  81743. "I3": "input",
  81744. "O": "output"
  81745. },
  81746. "connections": {
  81747. "I0": [ "0" ],
  81748. "I1": [ 3841 ],
  81749. "I2": [ 2861 ],
  81750. "I3": [ 3846 ],
  81751. "O": [ 3847 ]
  81752. }
  81753. },
  81754. "cpu_I.decode_RS2_SB_LUT4_O_10_I3_SB_LUT4_O": {
  81755. "hide_name": 0,
  81756. "type": "SB_LUT4",
  81757. "parameters": {
  81758. "LUT_INIT": "1111001111000000"
  81759. },
  81760. "attributes": {
  81761. "module_not_derived": "00000000000000000000000000000001",
  81762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81763. },
  81764. "port_directions": {
  81765. "I0": "input",
  81766. "I1": "input",
  81767. "I2": "input",
  81768. "I3": "input",
  81769. "O": "output"
  81770. },
  81771. "connections": {
  81772. "I0": [ "0" ],
  81773. "I1": [ 3848 ],
  81774. "I2": [ 3196 ],
  81775. "I3": [ 3849 ],
  81776. "O": [ 3846 ]
  81777. }
  81778. },
  81779. "cpu_I.decode_RS2_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  81780. "hide_name": 0,
  81781. "type": "SB_LUT4",
  81782. "parameters": {
  81783. "LUT_INIT": "1111001111000000"
  81784. },
  81785. "attributes": {
  81786. "module_not_derived": "00000000000000000000000000000001",
  81787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81788. },
  81789. "port_directions": {
  81790. "I0": "input",
  81791. "I1": "input",
  81792. "I2": "input",
  81793. "I3": "input",
  81794. "O": "output"
  81795. },
  81796. "connections": {
  81797. "I0": [ "0" ],
  81798. "I1": [ 2112 ],
  81799. "I2": [ 2291 ],
  81800. "I3": [ 2081 ],
  81801. "O": [ 3849 ]
  81802. }
  81803. },
  81804. "cpu_I.decode_RS2_SB_LUT4_O_11": {
  81805. "hide_name": 0,
  81806. "type": "SB_LUT4",
  81807. "parameters": {
  81808. "LUT_INIT": "1111110000110000"
  81809. },
  81810. "attributes": {
  81811. "module_not_derived": "00000000000000000000000000000001",
  81812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81813. },
  81814. "port_directions": {
  81815. "I0": "input",
  81816. "I1": "input",
  81817. "I2": "input",
  81818. "I3": "input",
  81819. "O": "output"
  81820. },
  81821. "connections": {
  81822. "I0": [ "0" ],
  81823. "I1": [ 3841 ],
  81824. "I2": [ 3850 ],
  81825. "I3": [ 2980 ],
  81826. "O": [ 3851 ]
  81827. }
  81828. },
  81829. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O": {
  81830. "hide_name": 0,
  81831. "type": "SB_LUT4",
  81832. "parameters": {
  81833. "LUT_INIT": "0000000011110011"
  81834. },
  81835. "attributes": {
  81836. "module_not_derived": "00000000000000000000000000000001",
  81837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81838. },
  81839. "port_directions": {
  81840. "I0": "input",
  81841. "I1": "input",
  81842. "I2": "input",
  81843. "I3": "input",
  81844. "O": "output"
  81845. },
  81846. "connections": {
  81847. "I0": [ "0" ],
  81848. "I1": [ 3848 ],
  81849. "I2": [ 3203 ],
  81850. "I3": [ 3852 ],
  81851. "O": [ 3850 ]
  81852. }
  81853. },
  81854. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  81855. "hide_name": 0,
  81856. "type": "SB_LUT4",
  81857. "parameters": {
  81858. "LUT_INIT": "0000000101000101"
  81859. },
  81860. "attributes": {
  81861. "module_not_derived": "00000000000000000000000000000001",
  81862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  81863. },
  81864. "port_directions": {
  81865. "I0": "input",
  81866. "I1": "input",
  81867. "I2": "input",
  81868. "I3": "input",
  81869. "O": "output"
  81870. },
  81871. "connections": {
  81872. "I0": [ 3848 ],
  81873. "I1": [ 2112 ],
  81874. "I2": [ 3853 ],
  81875. "I3": [ 2281 ],
  81876. "O": [ 3852 ]
  81877. }
  81878. },
  81879. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  81880. "hide_name": 0,
  81881. "type": "SB_LUT4",
  81882. "parameters": {
  81883. "LUT_INIT": "1100110011110000"
  81884. },
  81885. "attributes": {
  81886. "module_not_derived": "00000000000000000000000000000001",
  81887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81888. },
  81889. "port_directions": {
  81890. "I0": "input",
  81891. "I1": "input",
  81892. "I2": "input",
  81893. "I3": "input",
  81894. "O": "output"
  81895. },
  81896. "connections": {
  81897. "I0": [ "0" ],
  81898. "I1": [ 2151 ],
  81899. "I2": [ 3854 ],
  81900. "I3": [ 2080 ],
  81901. "O": [ 3853 ]
  81902. }
  81903. },
  81904. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  81905. "hide_name": 0,
  81906. "type": "SB_LUT4",
  81907. "parameters": {
  81908. "LUT_INIT": "1111000011001100"
  81909. },
  81910. "attributes": {
  81911. "module_not_derived": "00000000000000000000000000000001",
  81912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81913. },
  81914. "port_directions": {
  81915. "I0": "input",
  81916. "I1": "input",
  81917. "I2": "input",
  81918. "I3": "input",
  81919. "O": "output"
  81920. },
  81921. "connections": {
  81922. "I0": [ "0" ],
  81923. "I1": [ 2135 ],
  81924. "I2": [ 2178 ],
  81925. "I3": [ 2078 ],
  81926. "O": [ 3854 ]
  81927. }
  81928. },
  81929. "cpu_I.decode_RS2_SB_LUT4_O_12": {
  81930. "hide_name": 0,
  81931. "type": "SB_LUT4",
  81932. "parameters": {
  81933. "LUT_INIT": "1111110000110000"
  81934. },
  81935. "attributes": {
  81936. "module_not_derived": "00000000000000000000000000000001",
  81937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81938. },
  81939. "port_directions": {
  81940. "I0": "input",
  81941. "I1": "input",
  81942. "I2": "input",
  81943. "I3": "input",
  81944. "O": "output"
  81945. },
  81946. "connections": {
  81947. "I0": [ "0" ],
  81948. "I1": [ 3841 ],
  81949. "I2": [ 3855 ],
  81950. "I3": [ 2984 ],
  81951. "O": [ 3856 ]
  81952. }
  81953. },
  81954. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O": {
  81955. "hide_name": 0,
  81956. "type": "SB_LUT4",
  81957. "parameters": {
  81958. "LUT_INIT": "0000000011110011"
  81959. },
  81960. "attributes": {
  81961. "module_not_derived": "00000000000000000000000000000001",
  81962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  81963. },
  81964. "port_directions": {
  81965. "I0": "input",
  81966. "I1": "input",
  81967. "I2": "input",
  81968. "I3": "input",
  81969. "O": "output"
  81970. },
  81971. "connections": {
  81972. "I0": [ "0" ],
  81973. "I1": [ 3848 ],
  81974. "I2": [ 3208 ],
  81975. "I3": [ 3857 ],
  81976. "O": [ 3855 ]
  81977. }
  81978. },
  81979. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  81980. "hide_name": 0,
  81981. "type": "SB_LUT4",
  81982. "parameters": {
  81983. "LUT_INIT": "0000000101000101"
  81984. },
  81985. "attributes": {
  81986. "module_not_derived": "00000000000000000000000000000001",
  81987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  81988. },
  81989. "port_directions": {
  81990. "I0": "input",
  81991. "I1": "input",
  81992. "I2": "input",
  81993. "I3": "input",
  81994. "O": "output"
  81995. },
  81996. "connections": {
  81997. "I0": [ 3848 ],
  81998. "I1": [ 2112 ],
  81999. "I2": [ 3858 ],
  82000. "I3": [ 2292 ],
  82001. "O": [ 3857 ]
  82002. }
  82003. },
  82004. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  82005. "hide_name": 0,
  82006. "type": "SB_LUT4",
  82007. "parameters": {
  82008. "LUT_INIT": "1100110011110000"
  82009. },
  82010. "attributes": {
  82011. "module_not_derived": "00000000000000000000000000000001",
  82012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82013. },
  82014. "port_directions": {
  82015. "I0": "input",
  82016. "I1": "input",
  82017. "I2": "input",
  82018. "I3": "input",
  82019. "O": "output"
  82020. },
  82021. "connections": {
  82022. "I0": [ "0" ],
  82023. "I1": [ 2143 ],
  82024. "I2": [ 3859 ],
  82025. "I3": [ 2080 ],
  82026. "O": [ 3858 ]
  82027. }
  82028. },
  82029. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  82030. "hide_name": 0,
  82031. "type": "SB_LUT4",
  82032. "parameters": {
  82033. "LUT_INIT": "1111000011001100"
  82034. },
  82035. "attributes": {
  82036. "module_not_derived": "00000000000000000000000000000001",
  82037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82038. },
  82039. "port_directions": {
  82040. "I0": "input",
  82041. "I1": "input",
  82042. "I2": "input",
  82043. "I3": "input",
  82044. "O": "output"
  82045. },
  82046. "connections": {
  82047. "I0": [ "0" ],
  82048. "I1": [ 2127 ],
  82049. "I2": [ 2163 ],
  82050. "I3": [ 2078 ],
  82051. "O": [ 3859 ]
  82052. }
  82053. },
  82054. "cpu_I.decode_RS2_SB_LUT4_O_13": {
  82055. "hide_name": 0,
  82056. "type": "SB_LUT4",
  82057. "parameters": {
  82058. "LUT_INIT": "0000111100000011"
  82059. },
  82060. "attributes": {
  82061. "module_not_derived": "00000000000000000000000000000001",
  82062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82063. },
  82064. "port_directions": {
  82065. "I0": "input",
  82066. "I1": "input",
  82067. "I2": "input",
  82068. "I3": "input",
  82069. "O": "output"
  82070. },
  82071. "connections": {
  82072. "I0": [ "0" ],
  82073. "I1": [ 3841 ],
  82074. "I2": [ 3860 ],
  82075. "I3": [ 2966 ],
  82076. "O": [ 3861 ]
  82077. }
  82078. },
  82079. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O": {
  82080. "hide_name": 0,
  82081. "type": "SB_LUT4",
  82082. "parameters": {
  82083. "LUT_INIT": "0000011100000010"
  82084. },
  82085. "attributes": {
  82086. "module_not_derived": "00000000000000000000000000000001",
  82087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  82088. },
  82089. "port_directions": {
  82090. "I0": "input",
  82091. "I1": "input",
  82092. "I2": "input",
  82093. "I3": "input",
  82094. "O": "output"
  82095. },
  82096. "connections": {
  82097. "I0": [ 3848 ],
  82098. "I1": [ 3167 ],
  82099. "I2": [ 3841 ],
  82100. "I3": [ 3862 ],
  82101. "O": [ 3860 ]
  82102. }
  82103. },
  82104. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82105. "hide_name": 0,
  82106. "type": "SB_LUT4",
  82107. "parameters": {
  82108. "LUT_INIT": "0000001111001111"
  82109. },
  82110. "attributes": {
  82111. "module_not_derived": "00000000000000000000000000000001",
  82112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82113. },
  82114. "port_directions": {
  82115. "I0": "input",
  82116. "I1": "input",
  82117. "I2": "input",
  82118. "I3": "input",
  82119. "O": "output"
  82120. },
  82121. "connections": {
  82122. "I0": [ "0" ],
  82123. "I1": [ 2112 ],
  82124. "I2": [ 3863 ],
  82125. "I3": [ 2295 ],
  82126. "O": [ 3862 ]
  82127. }
  82128. },
  82129. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  82130. "hide_name": 0,
  82131. "type": "SB_LUT4",
  82132. "parameters": {
  82133. "LUT_INIT": "1100110011110000"
  82134. },
  82135. "attributes": {
  82136. "module_not_derived": "00000000000000000000000000000001",
  82137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82138. },
  82139. "port_directions": {
  82140. "I0": "input",
  82141. "I1": "input",
  82142. "I2": "input",
  82143. "I3": "input",
  82144. "O": "output"
  82145. },
  82146. "connections": {
  82147. "I0": [ "0" ],
  82148. "I1": [ 2153 ],
  82149. "I2": [ 3864 ],
  82150. "I3": [ 2080 ],
  82151. "O": [ 3863 ]
  82152. }
  82153. },
  82154. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  82155. "hide_name": 0,
  82156. "type": "SB_LUT4",
  82157. "parameters": {
  82158. "LUT_INIT": "1111000011001100"
  82159. },
  82160. "attributes": {
  82161. "module_not_derived": "00000000000000000000000000000001",
  82162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82163. },
  82164. "port_directions": {
  82165. "I0": "input",
  82166. "I1": "input",
  82167. "I2": "input",
  82168. "I3": "input",
  82169. "O": "output"
  82170. },
  82171. "connections": {
  82172. "I0": [ "0" ],
  82173. "I1": [ 2137 ],
  82174. "I2": [ 2174 ],
  82175. "I3": [ 2078 ],
  82176. "O": [ 3864 ]
  82177. }
  82178. },
  82179. "cpu_I.decode_RS2_SB_LUT4_O_14": {
  82180. "hide_name": 0,
  82181. "type": "SB_LUT4",
  82182. "parameters": {
  82183. "LUT_INIT": "1111110000110000"
  82184. },
  82185. "attributes": {
  82186. "module_not_derived": "00000000000000000000000000000001",
  82187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82188. },
  82189. "port_directions": {
  82190. "I0": "input",
  82191. "I1": "input",
  82192. "I2": "input",
  82193. "I3": "input",
  82194. "O": "output"
  82195. },
  82196. "connections": {
  82197. "I0": [ "0" ],
  82198. "I1": [ 3841 ],
  82199. "I2": [ 3865 ],
  82200. "I3": [ 2963 ],
  82201. "O": [ 3866 ]
  82202. }
  82203. },
  82204. "cpu_I.decode_RS2_SB_LUT4_O_15": {
  82205. "hide_name": 0,
  82206. "type": "SB_LUT4",
  82207. "parameters": {
  82208. "LUT_INIT": "0000111100000011"
  82209. },
  82210. "attributes": {
  82211. "module_not_derived": "00000000000000000000000000000001",
  82212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82213. },
  82214. "port_directions": {
  82215. "I0": "input",
  82216. "I1": "input",
  82217. "I2": "input",
  82218. "I3": "input",
  82219. "O": "output"
  82220. },
  82221. "connections": {
  82222. "I0": [ "0" ],
  82223. "I1": [ 3841 ],
  82224. "I2": [ 3867 ],
  82225. "I3": [ 2960 ],
  82226. "O": [ 3868 ]
  82227. }
  82228. },
  82229. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O": {
  82230. "hide_name": 0,
  82231. "type": "SB_LUT4",
  82232. "parameters": {
  82233. "LUT_INIT": "0000011100000010"
  82234. },
  82235. "attributes": {
  82236. "module_not_derived": "00000000000000000000000000000001",
  82237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  82238. },
  82239. "port_directions": {
  82240. "I0": "input",
  82241. "I1": "input",
  82242. "I2": "input",
  82243. "I3": "input",
  82244. "O": "output"
  82245. },
  82246. "connections": {
  82247. "I0": [ 3848 ],
  82248. "I1": [ 3146 ],
  82249. "I2": [ 3841 ],
  82250. "I3": [ 3869 ],
  82251. "O": [ 3867 ]
  82252. }
  82253. },
  82254. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82255. "hide_name": 0,
  82256. "type": "SB_LUT4",
  82257. "parameters": {
  82258. "LUT_INIT": "0000001111001111"
  82259. },
  82260. "attributes": {
  82261. "module_not_derived": "00000000000000000000000000000001",
  82262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82263. },
  82264. "port_directions": {
  82265. "I0": "input",
  82266. "I1": "input",
  82267. "I2": "input",
  82268. "I3": "input",
  82269. "O": "output"
  82270. },
  82271. "connections": {
  82272. "I0": [ "0" ],
  82273. "I1": [ 2112 ],
  82274. "I2": [ 3870 ],
  82275. "I3": [ 2297 ],
  82276. "O": [ 3869 ]
  82277. }
  82278. },
  82279. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  82280. "hide_name": 0,
  82281. "type": "SB_LUT4",
  82282. "parameters": {
  82283. "LUT_INIT": "1100110011110000"
  82284. },
  82285. "attributes": {
  82286. "module_not_derived": "00000000000000000000000000000001",
  82287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82288. },
  82289. "port_directions": {
  82290. "I0": "input",
  82291. "I1": "input",
  82292. "I2": "input",
  82293. "I3": "input",
  82294. "O": "output"
  82295. },
  82296. "connections": {
  82297. "I0": [ "0" ],
  82298. "I1": [ 2149 ],
  82299. "I2": [ 3871 ],
  82300. "I3": [ 2080 ],
  82301. "O": [ 3870 ]
  82302. }
  82303. },
  82304. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  82305. "hide_name": 0,
  82306. "type": "SB_LUT4",
  82307. "parameters": {
  82308. "LUT_INIT": "1111000011001100"
  82309. },
  82310. "attributes": {
  82311. "module_not_derived": "00000000000000000000000000000001",
  82312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82313. },
  82314. "port_directions": {
  82315. "I0": "input",
  82316. "I1": "input",
  82317. "I2": "input",
  82318. "I3": "input",
  82319. "O": "output"
  82320. },
  82321. "connections": {
  82322. "I0": [ "0" ],
  82323. "I1": [ 2133 ],
  82324. "I2": [ 2180 ],
  82325. "I3": [ 2078 ],
  82326. "O": [ 3871 ]
  82327. }
  82328. },
  82329. "cpu_I.decode_RS2_SB_LUT4_O_16": {
  82330. "hide_name": 0,
  82331. "type": "SB_LUT4",
  82332. "parameters": {
  82333. "LUT_INIT": "0000111100000011"
  82334. },
  82335. "attributes": {
  82336. "module_not_derived": "00000000000000000000000000000001",
  82337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82338. },
  82339. "port_directions": {
  82340. "I0": "input",
  82341. "I1": "input",
  82342. "I2": "input",
  82343. "I3": "input",
  82344. "O": "output"
  82345. },
  82346. "connections": {
  82347. "I0": [ "0" ],
  82348. "I1": [ 3841 ],
  82349. "I2": [ 3872 ],
  82350. "I3": [ 2957 ],
  82351. "O": [ 3873 ]
  82352. }
  82353. },
  82354. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O": {
  82355. "hide_name": 0,
  82356. "type": "SB_LUT4",
  82357. "parameters": {
  82358. "LUT_INIT": "0000011100000010"
  82359. },
  82360. "attributes": {
  82361. "module_not_derived": "00000000000000000000000000000001",
  82362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  82363. },
  82364. "port_directions": {
  82365. "I0": "input",
  82366. "I1": "input",
  82367. "I2": "input",
  82368. "I3": "input",
  82369. "O": "output"
  82370. },
  82371. "connections": {
  82372. "I0": [ 3848 ],
  82373. "I1": [ 3139 ],
  82374. "I2": [ 3841 ],
  82375. "I3": [ 3874 ],
  82376. "O": [ 3872 ]
  82377. }
  82378. },
  82379. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82380. "hide_name": 0,
  82381. "type": "SB_LUT4",
  82382. "parameters": {
  82383. "LUT_INIT": "0000001111001111"
  82384. },
  82385. "attributes": {
  82386. "module_not_derived": "00000000000000000000000000000001",
  82387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82388. },
  82389. "port_directions": {
  82390. "I0": "input",
  82391. "I1": "input",
  82392. "I2": "input",
  82393. "I3": "input",
  82394. "O": "output"
  82395. },
  82396. "connections": {
  82397. "I0": [ "0" ],
  82398. "I1": [ 2112 ],
  82399. "I2": [ 3875 ],
  82400. "I3": [ 2298 ],
  82401. "O": [ 3874 ]
  82402. }
  82403. },
  82404. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  82405. "hide_name": 0,
  82406. "type": "SB_LUT4",
  82407. "parameters": {
  82408. "LUT_INIT": "1100110011110000"
  82409. },
  82410. "attributes": {
  82411. "module_not_derived": "00000000000000000000000000000001",
  82412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82413. },
  82414. "port_directions": {
  82415. "I0": "input",
  82416. "I1": "input",
  82417. "I2": "input",
  82418. "I3": "input",
  82419. "O": "output"
  82420. },
  82421. "connections": {
  82422. "I0": [ "0" ],
  82423. "I1": [ 2141 ],
  82424. "I2": [ 3876 ],
  82425. "I3": [ 2080 ],
  82426. "O": [ 3875 ]
  82427. }
  82428. },
  82429. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  82430. "hide_name": 0,
  82431. "type": "SB_LUT4",
  82432. "parameters": {
  82433. "LUT_INIT": "1111000011001100"
  82434. },
  82435. "attributes": {
  82436. "module_not_derived": "00000000000000000000000000000001",
  82437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82438. },
  82439. "port_directions": {
  82440. "I0": "input",
  82441. "I1": "input",
  82442. "I2": "input",
  82443. "I3": "input",
  82444. "O": "output"
  82445. },
  82446. "connections": {
  82447. "I0": [ "0" ],
  82448. "I1": [ 2125 ],
  82449. "I2": [ 2167 ],
  82450. "I3": [ 2078 ],
  82451. "O": [ 3876 ]
  82452. }
  82453. },
  82454. "cpu_I.decode_RS2_SB_LUT4_O_17": {
  82455. "hide_name": 0,
  82456. "type": "SB_LUT4",
  82457. "parameters": {
  82458. "LUT_INIT": "1111110000110000"
  82459. },
  82460. "attributes": {
  82461. "module_not_derived": "00000000000000000000000000000001",
  82462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82463. },
  82464. "port_directions": {
  82465. "I0": "input",
  82466. "I1": "input",
  82467. "I2": "input",
  82468. "I3": "input",
  82469. "O": "output"
  82470. },
  82471. "connections": {
  82472. "I0": [ "0" ],
  82473. "I1": [ 3841 ],
  82474. "I2": [ 3877 ],
  82475. "I3": [ 2945 ],
  82476. "O": [ 3878 ]
  82477. }
  82478. },
  82479. "cpu_I.decode_RS2_SB_LUT4_O_17_I2_SB_LUT4_O": {
  82480. "hide_name": 0,
  82481. "type": "SB_LUT4",
  82482. "parameters": {
  82483. "LUT_INIT": "1111001111000000"
  82484. },
  82485. "attributes": {
  82486. "module_not_derived": "00000000000000000000000000000001",
  82487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82488. },
  82489. "port_directions": {
  82490. "I0": "input",
  82491. "I1": "input",
  82492. "I2": "input",
  82493. "I3": "input",
  82494. "O": "output"
  82495. },
  82496. "connections": {
  82497. "I0": [ "0" ],
  82498. "I1": [ 3848 ],
  82499. "I2": [ 3215 ],
  82500. "I3": [ 3879 ],
  82501. "O": [ 3877 ]
  82502. }
  82503. },
  82504. "cpu_I.decode_RS2_SB_LUT4_O_17_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82505. "hide_name": 0,
  82506. "type": "SB_LUT4",
  82507. "parameters": {
  82508. "LUT_INIT": "1111110000110000"
  82509. },
  82510. "attributes": {
  82511. "module_not_derived": "00000000000000000000000000000001",
  82512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82513. },
  82514. "port_directions": {
  82515. "I0": "input",
  82516. "I1": "input",
  82517. "I2": "input",
  82518. "I3": "input",
  82519. "O": "output"
  82520. },
  82521. "connections": {
  82522. "I0": [ "0" ],
  82523. "I1": [ 2112 ],
  82524. "I2": [ 2173 ],
  82525. "I3": [ 2299 ],
  82526. "O": [ 3879 ]
  82527. }
  82528. },
  82529. "cpu_I.decode_RS2_SB_LUT4_O_18": {
  82530. "hide_name": 0,
  82531. "type": "SB_LUT4",
  82532. "parameters": {
  82533. "LUT_INIT": "0000111100000011"
  82534. },
  82535. "attributes": {
  82536. "module_not_derived": "00000000000000000000000000000001",
  82537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82538. },
  82539. "port_directions": {
  82540. "I0": "input",
  82541. "I1": "input",
  82542. "I2": "input",
  82543. "I3": "input",
  82544. "O": "output"
  82545. },
  82546. "connections": {
  82547. "I0": [ "0" ],
  82548. "I1": [ 3841 ],
  82549. "I2": [ 3880 ],
  82550. "I3": [ 2942 ],
  82551. "O": [ 3881 ]
  82552. }
  82553. },
  82554. "cpu_I.decode_RS2_SB_LUT4_O_18_I2_SB_LUT4_O": {
  82555. "hide_name": 0,
  82556. "type": "SB_LUT4",
  82557. "parameters": {
  82558. "LUT_INIT": "0000011100000010"
  82559. },
  82560. "attributes": {
  82561. "module_not_derived": "00000000000000000000000000000001",
  82562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  82563. },
  82564. "port_directions": {
  82565. "I0": "input",
  82566. "I1": "input",
  82567. "I2": "input",
  82568. "I3": "input",
  82569. "O": "output"
  82570. },
  82571. "connections": {
  82572. "I0": [ 3848 ],
  82573. "I1": [ 3132 ],
  82574. "I2": [ 3841 ],
  82575. "I3": [ 3882 ],
  82576. "O": [ 3880 ]
  82577. }
  82578. },
  82579. "cpu_I.decode_RS2_SB_LUT4_O_18_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82580. "hide_name": 0,
  82581. "type": "SB_LUT4",
  82582. "parameters": {
  82583. "LUT_INIT": "0000001111001111"
  82584. },
  82585. "attributes": {
  82586. "module_not_derived": "00000000000000000000000000000001",
  82587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82588. },
  82589. "port_directions": {
  82590. "I0": "input",
  82591. "I1": "input",
  82592. "I2": "input",
  82593. "I3": "input",
  82594. "O": "output"
  82595. },
  82596. "connections": {
  82597. "I0": [ "0" ],
  82598. "I1": [ 2112 ],
  82599. "I2": [ 2187 ],
  82600. "I3": [ 2300 ],
  82601. "O": [ 3882 ]
  82602. }
  82603. },
  82604. "cpu_I.decode_RS2_SB_LUT4_O_19": {
  82605. "hide_name": 0,
  82606. "type": "SB_LUT4",
  82607. "parameters": {
  82608. "LUT_INIT": "1111110000110000"
  82609. },
  82610. "attributes": {
  82611. "module_not_derived": "00000000000000000000000000000001",
  82612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82613. },
  82614. "port_directions": {
  82615. "I0": "input",
  82616. "I1": "input",
  82617. "I2": "input",
  82618. "I3": "input",
  82619. "O": "output"
  82620. },
  82621. "connections": {
  82622. "I0": [ "0" ],
  82623. "I1": [ 3841 ],
  82624. "I2": [ 3883 ],
  82625. "I3": [ 2939 ],
  82626. "O": [ 3884 ]
  82627. }
  82628. },
  82629. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O": {
  82630. "hide_name": 0,
  82631. "type": "SB_LUT4",
  82632. "parameters": {
  82633. "LUT_INIT": "0000000011110011"
  82634. },
  82635. "attributes": {
  82636. "module_not_derived": "00000000000000000000000000000001",
  82637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82638. },
  82639. "port_directions": {
  82640. "I0": "input",
  82641. "I1": "input",
  82642. "I2": "input",
  82643. "I3": "input",
  82644. "O": "output"
  82645. },
  82646. "connections": {
  82647. "I0": [ "0" ],
  82648. "I1": [ 3848 ],
  82649. "I2": [ 3222 ],
  82650. "I3": [ 3885 ],
  82651. "O": [ 3883 ]
  82652. }
  82653. },
  82654. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82655. "hide_name": 0,
  82656. "type": "SB_LUT4",
  82657. "parameters": {
  82658. "LUT_INIT": "0000000101000101"
  82659. },
  82660. "attributes": {
  82661. "module_not_derived": "00000000000000000000000000000001",
  82662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  82663. },
  82664. "port_directions": {
  82665. "I0": "input",
  82666. "I1": "input",
  82667. "I2": "input",
  82668. "I3": "input",
  82669. "O": "output"
  82670. },
  82671. "connections": {
  82672. "I0": [ 3848 ],
  82673. "I1": [ 2112 ],
  82674. "I2": [ 3886 ],
  82675. "I3": [ 2271 ],
  82676. "O": [ 3885 ]
  82677. }
  82678. },
  82679. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  82680. "hide_name": 0,
  82681. "type": "SB_LUT4",
  82682. "parameters": {
  82683. "LUT_INIT": "1100110011110000"
  82684. },
  82685. "attributes": {
  82686. "module_not_derived": "00000000000000000000000000000001",
  82687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82688. },
  82689. "port_directions": {
  82690. "I0": "input",
  82691. "I1": "input",
  82692. "I2": "input",
  82693. "I3": "input",
  82694. "O": "output"
  82695. },
  82696. "connections": {
  82697. "I0": [ "0" ],
  82698. "I1": [ 2150 ],
  82699. "I2": [ 3887 ],
  82700. "I3": [ 2080 ],
  82701. "O": [ 3886 ]
  82702. }
  82703. },
  82704. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  82705. "hide_name": 0,
  82706. "type": "SB_LUT4",
  82707. "parameters": {
  82708. "LUT_INIT": "1111000011001100"
  82709. },
  82710. "attributes": {
  82711. "module_not_derived": "00000000000000000000000000000001",
  82712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82713. },
  82714. "port_directions": {
  82715. "I0": "input",
  82716. "I1": "input",
  82717. "I2": "input",
  82718. "I3": "input",
  82719. "O": "output"
  82720. },
  82721. "connections": {
  82722. "I0": [ "0" ],
  82723. "I1": [ 2134 ],
  82724. "I2": [ 2179 ],
  82725. "I3": [ 2078 ],
  82726. "O": [ 3887 ]
  82727. }
  82728. },
  82729. "cpu_I.decode_RS2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  82730. "hide_name": 0,
  82731. "type": "SB_LUT4",
  82732. "parameters": {
  82733. "LUT_INIT": "1111001111000000"
  82734. },
  82735. "attributes": {
  82736. "module_not_derived": "00000000000000000000000000000001",
  82737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82738. },
  82739. "port_directions": {
  82740. "I0": "input",
  82741. "I1": "input",
  82742. "I2": "input",
  82743. "I3": "input",
  82744. "O": "output"
  82745. },
  82746. "connections": {
  82747. "I0": [ "0" ],
  82748. "I1": [ 3848 ],
  82749. "I2": [ 3251 ],
  82750. "I3": [ 3888 ],
  82751. "O": [ 3844 ]
  82752. }
  82753. },
  82754. "cpu_I.decode_RS2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  82755. "hide_name": 0,
  82756. "type": "SB_LUT4",
  82757. "parameters": {
  82758. "LUT_INIT": "0000111100000011"
  82759. },
  82760. "attributes": {
  82761. "module_not_derived": "00000000000000000000000000000001",
  82762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82763. },
  82764. "port_directions": {
  82765. "I0": "input",
  82766. "I1": "input",
  82767. "I2": "input",
  82768. "I3": "input",
  82769. "O": "output"
  82770. },
  82771. "connections": {
  82772. "I0": [ "0" ],
  82773. "I1": [ 2112 ],
  82774. "I2": [ 2113 ],
  82775. "I3": [ 2284 ],
  82776. "O": [ 3888 ]
  82777. }
  82778. },
  82779. "cpu_I.decode_RS2_SB_LUT4_O_2": {
  82780. "hide_name": 0,
  82781. "type": "SB_LUT4",
  82782. "parameters": {
  82783. "LUT_INIT": "1111001111000000"
  82784. },
  82785. "attributes": {
  82786. "module_not_derived": "00000000000000000000000000000001",
  82787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82788. },
  82789. "port_directions": {
  82790. "I0": "input",
  82791. "I1": "input",
  82792. "I2": "input",
  82793. "I3": "input",
  82794. "O": "output"
  82795. },
  82796. "connections": {
  82797. "I0": [ "0" ],
  82798. "I1": [ 3841 ],
  82799. "I2": [ 3050 ],
  82800. "I3": [ 3889 ],
  82801. "O": [ 3890 ]
  82802. }
  82803. },
  82804. "cpu_I.decode_RS2_SB_LUT4_O_20": {
  82805. "hide_name": 0,
  82806. "type": "SB_LUT4",
  82807. "parameters": {
  82808. "LUT_INIT": "1111110000110000"
  82809. },
  82810. "attributes": {
  82811. "module_not_derived": "00000000000000000000000000000001",
  82812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82813. },
  82814. "port_directions": {
  82815. "I0": "input",
  82816. "I1": "input",
  82817. "I2": "input",
  82818. "I3": "input",
  82819. "O": "output"
  82820. },
  82821. "connections": {
  82822. "I0": [ "0" ],
  82823. "I1": [ 3841 ],
  82824. "I2": [ 3891 ],
  82825. "I3": [ 2925 ],
  82826. "O": [ 3892 ]
  82827. }
  82828. },
  82829. "cpu_I.decode_RS2_SB_LUT4_O_20_I2_SB_LUT4_O": {
  82830. "hide_name": 0,
  82831. "type": "SB_LUT4",
  82832. "parameters": {
  82833. "LUT_INIT": "1111001111000000"
  82834. },
  82835. "attributes": {
  82836. "module_not_derived": "00000000000000000000000000000001",
  82837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82838. },
  82839. "port_directions": {
  82840. "I0": "input",
  82841. "I1": "input",
  82842. "I2": "input",
  82843. "I3": "input",
  82844. "O": "output"
  82845. },
  82846. "connections": {
  82847. "I0": [ "0" ],
  82848. "I1": [ 3848 ],
  82849. "I2": [ 3125 ],
  82850. "I3": [ 3893 ],
  82851. "O": [ 3891 ]
  82852. }
  82853. },
  82854. "cpu_I.decode_RS2_SB_LUT4_O_20_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  82855. "hide_name": 0,
  82856. "type": "SB_LUT4",
  82857. "parameters": {
  82858. "LUT_INIT": "1111110000110000"
  82859. },
  82860. "attributes": {
  82861. "module_not_derived": "00000000000000000000000000000001",
  82862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82863. },
  82864. "port_directions": {
  82865. "I0": "input",
  82866. "I1": "input",
  82867. "I2": "input",
  82868. "I3": "input",
  82869. "O": "output"
  82870. },
  82871. "connections": {
  82872. "I0": [ "0" ],
  82873. "I1": [ 2112 ],
  82874. "I2": [ 2166 ],
  82875. "I3": [ 2272 ],
  82876. "O": [ 3893 ]
  82877. }
  82878. },
  82879. "cpu_I.decode_RS2_SB_LUT4_O_21": {
  82880. "hide_name": 0,
  82881. "type": "SB_LUT4",
  82882. "parameters": {
  82883. "LUT_INIT": "1111001111000000"
  82884. },
  82885. "attributes": {
  82886. "module_not_derived": "00000000000000000000000000000001",
  82887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82888. },
  82889. "port_directions": {
  82890. "I0": "input",
  82891. "I1": "input",
  82892. "I2": "input",
  82893. "I3": "input",
  82894. "O": "output"
  82895. },
  82896. "connections": {
  82897. "I0": [ "0" ],
  82898. "I1": [ 3841 ],
  82899. "I2": [ 2860 ],
  82900. "I3": [ 3894 ],
  82901. "O": [ 3895 ]
  82902. }
  82903. },
  82904. "cpu_I.decode_RS2_SB_LUT4_O_21_I3_SB_LUT4_O": {
  82905. "hide_name": 0,
  82906. "type": "SB_LUT4",
  82907. "parameters": {
  82908. "LUT_INIT": "1111001111000000"
  82909. },
  82910. "attributes": {
  82911. "module_not_derived": "00000000000000000000000000000001",
  82912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82913. },
  82914. "port_directions": {
  82915. "I0": "input",
  82916. "I1": "input",
  82917. "I2": "input",
  82918. "I3": "input",
  82919. "O": "output"
  82920. },
  82921. "connections": {
  82922. "I0": [ "0" ],
  82923. "I1": [ 3848 ],
  82924. "I2": [ 3234 ],
  82925. "I3": [ 3896 ],
  82926. "O": [ 3894 ]
  82927. }
  82928. },
  82929. "cpu_I.decode_RS2_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  82930. "hide_name": 0,
  82931. "type": "SB_LUT4",
  82932. "parameters": {
  82933. "LUT_INIT": "1111001111000000"
  82934. },
  82935. "attributes": {
  82936. "module_not_derived": "00000000000000000000000000000001",
  82937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82938. },
  82939. "port_directions": {
  82940. "I0": "input",
  82941. "I1": "input",
  82942. "I2": "input",
  82943. "I3": "input",
  82944. "O": "output"
  82945. },
  82946. "connections": {
  82947. "I0": [ "0" ],
  82948. "I1": [ 2112 ],
  82949. "I2": [ 2293 ],
  82950. "I3": [ 2116 ],
  82951. "O": [ 3896 ]
  82952. }
  82953. },
  82954. "cpu_I.decode_RS2_SB_LUT4_O_22": {
  82955. "hide_name": 0,
  82956. "type": "SB_LUT4",
  82957. "parameters": {
  82958. "LUT_INIT": "1111001111000000"
  82959. },
  82960. "attributes": {
  82961. "module_not_derived": "00000000000000000000000000000001",
  82962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82963. },
  82964. "port_directions": {
  82965. "I0": "input",
  82966. "I1": "input",
  82967. "I2": "input",
  82968. "I3": "input",
  82969. "O": "output"
  82970. },
  82971. "connections": {
  82972. "I0": [ "0" ],
  82973. "I1": [ 3841 ],
  82974. "I2": [ 2922 ],
  82975. "I3": [ 3897 ],
  82976. "O": [ 3898 ]
  82977. }
  82978. },
  82979. "cpu_I.decode_RS2_SB_LUT4_O_22_I3_SB_LUT4_O": {
  82980. "hide_name": 0,
  82981. "type": "SB_LUT4",
  82982. "parameters": {
  82983. "LUT_INIT": "1111001111000000"
  82984. },
  82985. "attributes": {
  82986. "module_not_derived": "00000000000000000000000000000001",
  82987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  82988. },
  82989. "port_directions": {
  82990. "I0": "input",
  82991. "I1": "input",
  82992. "I2": "input",
  82993. "I3": "input",
  82994. "O": "output"
  82995. },
  82996. "connections": {
  82997. "I0": [ "0" ],
  82998. "I1": [ 3848 ],
  82999. "I2": [ 3118 ],
  83000. "I3": [ 3899 ],
  83001. "O": [ 3897 ]
  83002. }
  83003. },
  83004. "cpu_I.decode_RS2_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83005. "hide_name": 0,
  83006. "type": "SB_LUT4",
  83007. "parameters": {
  83008. "LUT_INIT": "1111110000110000"
  83009. },
  83010. "attributes": {
  83011. "module_not_derived": "00000000000000000000000000000001",
  83012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83013. },
  83014. "port_directions": {
  83015. "I0": "input",
  83016. "I1": "input",
  83017. "I2": "input",
  83018. "I3": "input",
  83019. "O": "output"
  83020. },
  83021. "connections": {
  83022. "I0": [ "0" ],
  83023. "I1": [ 2112 ],
  83024. "I2": [ 2177 ],
  83025. "I3": [ 2273 ],
  83026. "O": [ 3899 ]
  83027. }
  83028. },
  83029. "cpu_I.decode_RS2_SB_LUT4_O_23": {
  83030. "hide_name": 0,
  83031. "type": "SB_LUT4",
  83032. "parameters": {
  83033. "LUT_INIT": "0000000011110011"
  83034. },
  83035. "attributes": {
  83036. "module_not_derived": "00000000000000000000000000000001",
  83037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83038. },
  83039. "port_directions": {
  83040. "I0": "input",
  83041. "I1": "input",
  83042. "I2": "input",
  83043. "I3": "input",
  83044. "O": "output"
  83045. },
  83046. "connections": {
  83047. "I0": [ "0" ],
  83048. "I1": [ 3841 ],
  83049. "I2": [ 2919 ],
  83050. "I3": [ 3900 ],
  83051. "O": [ 3901 ]
  83052. }
  83053. },
  83054. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O": {
  83055. "hide_name": 0,
  83056. "type": "SB_LUT4",
  83057. "parameters": {
  83058. "LUT_INIT": "0000011100000010"
  83059. },
  83060. "attributes": {
  83061. "module_not_derived": "00000000000000000000000000000001",
  83062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83063. },
  83064. "port_directions": {
  83065. "I0": "input",
  83066. "I1": "input",
  83067. "I2": "input",
  83068. "I3": "input",
  83069. "O": "output"
  83070. },
  83071. "connections": {
  83072. "I0": [ 3848 ],
  83073. "I1": [ 3111 ],
  83074. "I2": [ 3841 ],
  83075. "I3": [ 3902 ],
  83076. "O": [ 3900 ]
  83077. }
  83078. },
  83079. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83080. "hide_name": 0,
  83081. "type": "SB_LUT4",
  83082. "parameters": {
  83083. "LUT_INIT": "0000001111001111"
  83084. },
  83085. "attributes": {
  83086. "module_not_derived": "00000000000000000000000000000001",
  83087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83088. },
  83089. "port_directions": {
  83090. "I0": "input",
  83091. "I1": "input",
  83092. "I2": "input",
  83093. "I3": "input",
  83094. "O": "output"
  83095. },
  83096. "connections": {
  83097. "I0": [ "0" ],
  83098. "I1": [ 2112 ],
  83099. "I2": [ 3903 ],
  83100. "I3": [ 2274 ],
  83101. "O": [ 3902 ]
  83102. }
  83103. },
  83104. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  83105. "hide_name": 0,
  83106. "type": "SB_LUT4",
  83107. "parameters": {
  83108. "LUT_INIT": "1100110011110000"
  83109. },
  83110. "attributes": {
  83111. "module_not_derived": "00000000000000000000000000000001",
  83112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83113. },
  83114. "port_directions": {
  83115. "I0": "input",
  83116. "I1": "input",
  83117. "I2": "input",
  83118. "I3": "input",
  83119. "O": "output"
  83120. },
  83121. "connections": {
  83122. "I0": [ "0" ],
  83123. "I1": [ 2144 ],
  83124. "I2": [ 3904 ],
  83125. "I3": [ 2080 ],
  83126. "O": [ 3903 ]
  83127. }
  83128. },
  83129. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  83130. "hide_name": 0,
  83131. "type": "SB_LUT4",
  83132. "parameters": {
  83133. "LUT_INIT": "1111000011001100"
  83134. },
  83135. "attributes": {
  83136. "module_not_derived": "00000000000000000000000000000001",
  83137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83138. },
  83139. "port_directions": {
  83140. "I0": "input",
  83141. "I1": "input",
  83142. "I2": "input",
  83143. "I3": "input",
  83144. "O": "output"
  83145. },
  83146. "connections": {
  83147. "I0": [ "0" ],
  83148. "I1": [ 2128 ],
  83149. "I2": [ 2162 ],
  83150. "I3": [ 2078 ],
  83151. "O": [ 3904 ]
  83152. }
  83153. },
  83154. "cpu_I.decode_RS2_SB_LUT4_O_24": {
  83155. "hide_name": 0,
  83156. "type": "SB_LUT4",
  83157. "parameters": {
  83158. "LUT_INIT": "0000000011110011"
  83159. },
  83160. "attributes": {
  83161. "module_not_derived": "00000000000000000000000000000001",
  83162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83163. },
  83164. "port_directions": {
  83165. "I0": "input",
  83166. "I1": "input",
  83167. "I2": "input",
  83168. "I3": "input",
  83169. "O": "output"
  83170. },
  83171. "connections": {
  83172. "I0": [ "0" ],
  83173. "I1": [ 3841 ],
  83174. "I2": [ 2916 ],
  83175. "I3": [ 3905 ],
  83176. "O": [ 3906 ]
  83177. }
  83178. },
  83179. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O": {
  83180. "hide_name": 0,
  83181. "type": "SB_LUT4",
  83182. "parameters": {
  83183. "LUT_INIT": "0000011100000010"
  83184. },
  83185. "attributes": {
  83186. "module_not_derived": "00000000000000000000000000000001",
  83187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83188. },
  83189. "port_directions": {
  83190. "I0": "input",
  83191. "I1": "input",
  83192. "I2": "input",
  83193. "I3": "input",
  83194. "O": "output"
  83195. },
  83196. "connections": {
  83197. "I0": [ 3848 ],
  83198. "I1": [ 3104 ],
  83199. "I2": [ 3841 ],
  83200. "I3": [ 3907 ],
  83201. "O": [ 3905 ]
  83202. }
  83203. },
  83204. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83205. "hide_name": 0,
  83206. "type": "SB_LUT4",
  83207. "parameters": {
  83208. "LUT_INIT": "0000001111001111"
  83209. },
  83210. "attributes": {
  83211. "module_not_derived": "00000000000000000000000000000001",
  83212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83213. },
  83214. "port_directions": {
  83215. "I0": "input",
  83216. "I1": "input",
  83217. "I2": "input",
  83218. "I3": "input",
  83219. "O": "output"
  83220. },
  83221. "connections": {
  83222. "I0": [ "0" ],
  83223. "I1": [ 2112 ],
  83224. "I2": [ 3908 ],
  83225. "I3": [ 2275 ],
  83226. "O": [ 3907 ]
  83227. }
  83228. },
  83229. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  83230. "hide_name": 0,
  83231. "type": "SB_LUT4",
  83232. "parameters": {
  83233. "LUT_INIT": "1100110011110000"
  83234. },
  83235. "attributes": {
  83236. "module_not_derived": "00000000000000000000000000000001",
  83237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83238. },
  83239. "port_directions": {
  83240. "I0": "input",
  83241. "I1": "input",
  83242. "I2": "input",
  83243. "I3": "input",
  83244. "O": "output"
  83245. },
  83246. "connections": {
  83247. "I0": [ "0" ],
  83248. "I1": [ 2148 ],
  83249. "I2": [ 3909 ],
  83250. "I3": [ 2080 ],
  83251. "O": [ 3908 ]
  83252. }
  83253. },
  83254. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  83255. "hide_name": 0,
  83256. "type": "SB_LUT4",
  83257. "parameters": {
  83258. "LUT_INIT": "1111000011001100"
  83259. },
  83260. "attributes": {
  83261. "module_not_derived": "00000000000000000000000000000001",
  83262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83263. },
  83264. "port_directions": {
  83265. "I0": "input",
  83266. "I1": "input",
  83267. "I2": "input",
  83268. "I3": "input",
  83269. "O": "output"
  83270. },
  83271. "connections": {
  83272. "I0": [ "0" ],
  83273. "I1": [ 2132 ],
  83274. "I2": [ 2181 ],
  83275. "I3": [ 2078 ],
  83276. "O": [ 3909 ]
  83277. }
  83278. },
  83279. "cpu_I.decode_RS2_SB_LUT4_O_25": {
  83280. "hide_name": 0,
  83281. "type": "SB_LUT4",
  83282. "parameters": {
  83283. "LUT_INIT": "0000000011110011"
  83284. },
  83285. "attributes": {
  83286. "module_not_derived": "00000000000000000000000000000001",
  83287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83288. },
  83289. "port_directions": {
  83290. "I0": "input",
  83291. "I1": "input",
  83292. "I2": "input",
  83293. "I3": "input",
  83294. "O": "output"
  83295. },
  83296. "connections": {
  83297. "I0": [ "0" ],
  83298. "I1": [ 3841 ],
  83299. "I2": [ 2904 ],
  83300. "I3": [ 3910 ],
  83301. "O": [ 3911 ]
  83302. }
  83303. },
  83304. "cpu_I.decode_RS2_SB_LUT4_O_25_I3_SB_LUT4_O": {
  83305. "hide_name": 0,
  83306. "type": "SB_LUT4",
  83307. "parameters": {
  83308. "LUT_INIT": "0000011100000010"
  83309. },
  83310. "attributes": {
  83311. "module_not_derived": "00000000000000000000000000000001",
  83312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83313. },
  83314. "port_directions": {
  83315. "I0": "input",
  83316. "I1": "input",
  83317. "I2": "input",
  83318. "I3": "input",
  83319. "O": "output"
  83320. },
  83321. "connections": {
  83322. "I0": [ 3848 ],
  83323. "I1": [ 3099 ],
  83324. "I2": [ 3841 ],
  83325. "I3": [ 3912 ],
  83326. "O": [ 3910 ]
  83327. }
  83328. },
  83329. "cpu_I.decode_RS2_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83330. "hide_name": 0,
  83331. "type": "SB_LUT4",
  83332. "parameters": {
  83333. "LUT_INIT": "0000001111001111"
  83334. },
  83335. "attributes": {
  83336. "module_not_derived": "00000000000000000000000000000001",
  83337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83338. },
  83339. "port_directions": {
  83340. "I0": "input",
  83341. "I1": "input",
  83342. "I2": "input",
  83343. "I3": "input",
  83344. "O": "output"
  83345. },
  83346. "connections": {
  83347. "I0": [ "0" ],
  83348. "I1": [ 2112 ],
  83349. "I2": [ 2170 ],
  83350. "I3": [ 2276 ],
  83351. "O": [ 3912 ]
  83352. }
  83353. },
  83354. "cpu_I.decode_RS2_SB_LUT4_O_26": {
  83355. "hide_name": 0,
  83356. "type": "SB_LUT4",
  83357. "parameters": {
  83358. "LUT_INIT": "1111001111000000"
  83359. },
  83360. "attributes": {
  83361. "module_not_derived": "00000000000000000000000000000001",
  83362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83363. },
  83364. "port_directions": {
  83365. "I0": "input",
  83366. "I1": "input",
  83367. "I2": "input",
  83368. "I3": "input",
  83369. "O": "output"
  83370. },
  83371. "connections": {
  83372. "I0": [ "0" ],
  83373. "I1": [ 3841 ],
  83374. "I2": [ 2901 ],
  83375. "I3": [ 3913 ],
  83376. "O": [ 3914 ]
  83377. }
  83378. },
  83379. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O": {
  83380. "hide_name": 0,
  83381. "type": "SB_LUT4",
  83382. "parameters": {
  83383. "LUT_INIT": "0000000011110011"
  83384. },
  83385. "attributes": {
  83386. "module_not_derived": "00000000000000000000000000000001",
  83387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83388. },
  83389. "port_directions": {
  83390. "I0": "input",
  83391. "I1": "input",
  83392. "I2": "input",
  83393. "I3": "input",
  83394. "O": "output"
  83395. },
  83396. "connections": {
  83397. "I0": [ "0" ],
  83398. "I1": [ 3848 ],
  83399. "I2": [ 3088 ],
  83400. "I3": [ 3915 ],
  83401. "O": [ 3913 ]
  83402. }
  83403. },
  83404. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83405. "hide_name": 0,
  83406. "type": "SB_LUT4",
  83407. "parameters": {
  83408. "LUT_INIT": "0000000101000101"
  83409. },
  83410. "attributes": {
  83411. "module_not_derived": "00000000000000000000000000000001",
  83412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83413. },
  83414. "port_directions": {
  83415. "I0": "input",
  83416. "I1": "input",
  83417. "I2": "input",
  83418. "I3": "input",
  83419. "O": "output"
  83420. },
  83421. "connections": {
  83422. "I0": [ 3848 ],
  83423. "I1": [ 2112 ],
  83424. "I2": [ 3916 ],
  83425. "I3": [ 2277 ],
  83426. "O": [ 3915 ]
  83427. }
  83428. },
  83429. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  83430. "hide_name": 0,
  83431. "type": "SB_LUT4",
  83432. "parameters": {
  83433. "LUT_INIT": "1100110011110000"
  83434. },
  83435. "attributes": {
  83436. "module_not_derived": "00000000000000000000000000000001",
  83437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83438. },
  83439. "port_directions": {
  83440. "I0": "input",
  83441. "I1": "input",
  83442. "I2": "input",
  83443. "I3": "input",
  83444. "O": "output"
  83445. },
  83446. "connections": {
  83447. "I0": [ "0" ],
  83448. "I1": [ 2074 ],
  83449. "I2": [ 3917 ],
  83450. "I3": [ 2080 ],
  83451. "O": [ 3916 ]
  83452. }
  83453. },
  83454. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  83455. "hide_name": 0,
  83456. "type": "SB_LUT4",
  83457. "parameters": {
  83458. "LUT_INIT": "1111000011001100"
  83459. },
  83460. "attributes": {
  83461. "module_not_derived": "00000000000000000000000000000001",
  83462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83463. },
  83464. "port_directions": {
  83465. "I0": "input",
  83466. "I1": "input",
  83467. "I2": "input",
  83468. "I3": "input",
  83469. "O": "output"
  83470. },
  83471. "connections": {
  83472. "I0": [ "0" ],
  83473. "I1": [ 2051 ],
  83474. "I2": [ 2123 ],
  83475. "I3": [ 2078 ],
  83476. "O": [ 3917 ]
  83477. }
  83478. },
  83479. "cpu_I.decode_RS2_SB_LUT4_O_27": {
  83480. "hide_name": 0,
  83481. "type": "SB_LUT4",
  83482. "parameters": {
  83483. "LUT_INIT": "1111001111000000"
  83484. },
  83485. "attributes": {
  83486. "module_not_derived": "00000000000000000000000000000001",
  83487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83488. },
  83489. "port_directions": {
  83490. "I0": "input",
  83491. "I1": "input",
  83492. "I2": "input",
  83493. "I3": "input",
  83494. "O": "output"
  83495. },
  83496. "connections": {
  83497. "I0": [ "0" ],
  83498. "I1": [ 3841 ],
  83499. "I2": [ 2888 ],
  83500. "I3": [ 3918 ],
  83501. "O": [ 3919 ]
  83502. }
  83503. },
  83504. "cpu_I.decode_RS2_SB_LUT4_O_27_I3_SB_LUT4_O": {
  83505. "hide_name": 0,
  83506. "type": "SB_LUT4",
  83507. "parameters": {
  83508. "LUT_INIT": "0000000011110011"
  83509. },
  83510. "attributes": {
  83511. "module_not_derived": "00000000000000000000000000000001",
  83512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83513. },
  83514. "port_directions": {
  83515. "I0": "input",
  83516. "I1": "input",
  83517. "I2": "input",
  83518. "I3": "input",
  83519. "O": "output"
  83520. },
  83521. "connections": {
  83522. "I0": [ "0" ],
  83523. "I1": [ 3848 ],
  83524. "I2": [ 3271 ],
  83525. "I3": [ 3920 ],
  83526. "O": [ 3918 ]
  83527. }
  83528. },
  83529. "cpu_I.decode_RS2_SB_LUT4_O_27_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83530. "hide_name": 0,
  83531. "type": "SB_LUT4",
  83532. "parameters": {
  83533. "LUT_INIT": "0000000101000101"
  83534. },
  83535. "attributes": {
  83536. "module_not_derived": "00000000000000000000000000000001",
  83537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83538. },
  83539. "port_directions": {
  83540. "I0": "input",
  83541. "I1": "input",
  83542. "I2": "input",
  83543. "I3": "input",
  83544. "O": "output"
  83545. },
  83546. "connections": {
  83547. "I0": [ 3848 ],
  83548. "I1": [ 2112 ],
  83549. "I2": [ 2119 ],
  83550. "I3": [ 2278 ],
  83551. "O": [ 3920 ]
  83552. }
  83553. },
  83554. "cpu_I.decode_RS2_SB_LUT4_O_28": {
  83555. "hide_name": 0,
  83556. "type": "SB_LUT4",
  83557. "parameters": {
  83558. "LUT_INIT": "1111001111000000"
  83559. },
  83560. "attributes": {
  83561. "module_not_derived": "00000000000000000000000000000001",
  83562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83563. },
  83564. "port_directions": {
  83565. "I0": "input",
  83566. "I1": "input",
  83567. "I2": "input",
  83568. "I3": "input",
  83569. "O": "output"
  83570. },
  83571. "connections": {
  83572. "I0": [ "0" ],
  83573. "I1": [ 3841 ],
  83574. "I2": [ 2885 ],
  83575. "I3": [ 3921 ],
  83576. "O": [ 3922 ]
  83577. }
  83578. },
  83579. "cpu_I.decode_RS2_SB_LUT4_O_28_I3_SB_LUT4_O": {
  83580. "hide_name": 0,
  83581. "type": "SB_LUT4",
  83582. "parameters": {
  83583. "LUT_INIT": "0000000011110011"
  83584. },
  83585. "attributes": {
  83586. "module_not_derived": "00000000000000000000000000000001",
  83587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83588. },
  83589. "port_directions": {
  83590. "I0": "input",
  83591. "I1": "input",
  83592. "I2": "input",
  83593. "I3": "input",
  83594. "O": "output"
  83595. },
  83596. "connections": {
  83597. "I0": [ "0" ],
  83598. "I1": [ 3848 ],
  83599. "I2": [ 3266 ],
  83600. "I3": [ 3923 ],
  83601. "O": [ 3921 ]
  83602. }
  83603. },
  83604. "cpu_I.decode_RS2_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83605. "hide_name": 0,
  83606. "type": "SB_LUT4",
  83607. "parameters": {
  83608. "LUT_INIT": "0000000101000101"
  83609. },
  83610. "attributes": {
  83611. "module_not_derived": "00000000000000000000000000000001",
  83612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83613. },
  83614. "port_directions": {
  83615. "I0": "input",
  83616. "I1": "input",
  83617. "I2": "input",
  83618. "I3": "input",
  83619. "O": "output"
  83620. },
  83621. "connections": {
  83622. "I0": [ 3848 ],
  83623. "I1": [ 2112 ],
  83624. "I2": [ 2106 ],
  83625. "I3": [ 2279 ],
  83626. "O": [ 3923 ]
  83627. }
  83628. },
  83629. "cpu_I.decode_RS2_SB_LUT4_O_29": {
  83630. "hide_name": 0,
  83631. "type": "SB_LUT4",
  83632. "parameters": {
  83633. "LUT_INIT": "1111001111000000"
  83634. },
  83635. "attributes": {
  83636. "module_not_derived": "00000000000000000000000000000001",
  83637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83638. },
  83639. "port_directions": {
  83640. "I0": "input",
  83641. "I1": "input",
  83642. "I2": "input",
  83643. "I3": "input",
  83644. "O": "output"
  83645. },
  83646. "connections": {
  83647. "I0": [ "0" ],
  83648. "I1": [ 3841 ],
  83649. "I2": [ 2875 ],
  83650. "I3": [ 3924 ],
  83651. "O": [ 3925 ]
  83652. }
  83653. },
  83654. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O": {
  83655. "hide_name": 0,
  83656. "type": "SB_LUT4",
  83657. "parameters": {
  83658. "LUT_INIT": "1111001111000000"
  83659. },
  83660. "attributes": {
  83661. "module_not_derived": "00000000000000000000000000000001",
  83662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83663. },
  83664. "port_directions": {
  83665. "I0": "input",
  83666. "I1": "input",
  83667. "I2": "input",
  83668. "I3": "input",
  83669. "O": "output"
  83670. },
  83671. "connections": {
  83672. "I0": [ "0" ],
  83673. "I1": [ 3848 ],
  83674. "I2": [ 3261 ],
  83675. "I3": [ 3926 ],
  83676. "O": [ 3924 ]
  83677. }
  83678. },
  83679. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83680. "hide_name": 0,
  83681. "type": "SB_LUT4",
  83682. "parameters": {
  83683. "LUT_INIT": "0000111100000011"
  83684. },
  83685. "attributes": {
  83686. "module_not_derived": "00000000000000000000000000000001",
  83687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83688. },
  83689. "port_directions": {
  83690. "I0": "input",
  83691. "I1": "input",
  83692. "I2": "input",
  83693. "I3": "input",
  83694. "O": "output"
  83695. },
  83696. "connections": {
  83697. "I0": [ "0" ],
  83698. "I1": [ 2112 ],
  83699. "I2": [ 3927 ],
  83700. "I3": [ 2280 ],
  83701. "O": [ 3926 ]
  83702. }
  83703. },
  83704. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  83705. "hide_name": 0,
  83706. "type": "SB_LUT4",
  83707. "parameters": {
  83708. "LUT_INIT": "0000010100000011"
  83709. },
  83710. "attributes": {
  83711. "module_not_derived": "00000000000000000000000000000001",
  83712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83713. },
  83714. "port_directions": {
  83715. "I0": "input",
  83716. "I1": "input",
  83717. "I2": "input",
  83718. "I3": "input",
  83719. "O": "output"
  83720. },
  83721. "connections": {
  83722. "I0": [ 2062 ],
  83723. "I1": [ 3928 ],
  83724. "I2": [ 2112 ],
  83725. "I3": [ 2080 ],
  83726. "O": [ 3927 ]
  83727. }
  83728. },
  83729. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  83730. "hide_name": 0,
  83731. "type": "SB_LUT4",
  83732. "parameters": {
  83733. "LUT_INIT": "1111000011001100"
  83734. },
  83735. "attributes": {
  83736. "module_not_derived": "00000000000000000000000000000001",
  83737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83738. },
  83739. "port_directions": {
  83740. "I0": "input",
  83741. "I1": "input",
  83742. "I2": "input",
  83743. "I3": "input",
  83744. "O": "output"
  83745. },
  83746. "connections": {
  83747. "I0": [ "0" ],
  83748. "I1": [ 2039 ],
  83749. "I2": [ 2082 ],
  83750. "I3": [ 2078 ],
  83751. "O": [ 3928 ]
  83752. }
  83753. },
  83754. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O": {
  83755. "hide_name": 0,
  83756. "type": "SB_LUT4",
  83757. "parameters": {
  83758. "LUT_INIT": "0000000011110011"
  83759. },
  83760. "attributes": {
  83761. "module_not_derived": "00000000000000000000000000000001",
  83762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83763. },
  83764. "port_directions": {
  83765. "I0": "input",
  83766. "I1": "input",
  83767. "I2": "input",
  83768. "I3": "input",
  83769. "O": "output"
  83770. },
  83771. "connections": {
  83772. "I0": [ "0" ],
  83773. "I1": [ 3848 ],
  83774. "I2": [ 3184 ],
  83775. "I3": [ 3929 ],
  83776. "O": [ 3889 ]
  83777. }
  83778. },
  83779. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83780. "hide_name": 0,
  83781. "type": "SB_LUT4",
  83782. "parameters": {
  83783. "LUT_INIT": "0000000101000101"
  83784. },
  83785. "attributes": {
  83786. "module_not_derived": "00000000000000000000000000000001",
  83787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83788. },
  83789. "port_directions": {
  83790. "I0": "input",
  83791. "I1": "input",
  83792. "I2": "input",
  83793. "I3": "input",
  83794. "O": "output"
  83795. },
  83796. "connections": {
  83797. "I0": [ 3848 ],
  83798. "I1": [ 2112 ],
  83799. "I2": [ 3930 ],
  83800. "I3": [ 2285 ],
  83801. "O": [ 3929 ]
  83802. }
  83803. },
  83804. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  83805. "hide_name": 0,
  83806. "type": "SB_LUT4",
  83807. "parameters": {
  83808. "LUT_INIT": "1100110011110000"
  83809. },
  83810. "attributes": {
  83811. "module_not_derived": "00000000000000000000000000000001",
  83812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83813. },
  83814. "port_directions": {
  83815. "I0": "input",
  83816. "I1": "input",
  83817. "I2": "input",
  83818. "I3": "input",
  83819. "O": "output"
  83820. },
  83821. "connections": {
  83822. "I0": [ "0" ],
  83823. "I1": [ 2060 ],
  83824. "I2": [ 3931 ],
  83825. "I3": [ 2080 ],
  83826. "O": [ 3930 ]
  83827. }
  83828. },
  83829. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  83830. "hide_name": 0,
  83831. "type": "SB_LUT4",
  83832. "parameters": {
  83833. "LUT_INIT": "1111000011001100"
  83834. },
  83835. "attributes": {
  83836. "module_not_derived": "00000000000000000000000000000001",
  83837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83838. },
  83839. "port_directions": {
  83840. "I0": "input",
  83841. "I1": "input",
  83842. "I2": "input",
  83843. "I3": "input",
  83844. "O": "output"
  83845. },
  83846. "connections": {
  83847. "I0": [ "0" ],
  83848. "I1": [ 2037 ],
  83849. "I2": [ 2086 ],
  83850. "I3": [ 2078 ],
  83851. "O": [ 3931 ]
  83852. }
  83853. },
  83854. "cpu_I.decode_RS2_SB_LUT4_O_3": {
  83855. "hide_name": 0,
  83856. "type": "SB_LUT4",
  83857. "parameters": {
  83858. "LUT_INIT": "1111001111000000"
  83859. },
  83860. "attributes": {
  83861. "module_not_derived": "00000000000000000000000000000001",
  83862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83863. },
  83864. "port_directions": {
  83865. "I0": "input",
  83866. "I1": "input",
  83867. "I2": "input",
  83868. "I3": "input",
  83869. "O": "output"
  83870. },
  83871. "connections": {
  83872. "I0": [ "0" ],
  83873. "I1": [ 3841 ],
  83874. "I2": [ 3038 ],
  83875. "I3": [ 3932 ],
  83876. "O": [ 3933 ]
  83877. }
  83878. },
  83879. "cpu_I.decode_RS2_SB_LUT4_O_30": {
  83880. "hide_name": 0,
  83881. "type": "SB_LUT4",
  83882. "parameters": {
  83883. "LUT_INIT": "1111001111000000"
  83884. },
  83885. "attributes": {
  83886. "module_not_derived": "00000000000000000000000000000001",
  83887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83888. },
  83889. "port_directions": {
  83890. "I0": "input",
  83891. "I1": "input",
  83892. "I2": "input",
  83893. "I3": "input",
  83894. "O": "output"
  83895. },
  83896. "connections": {
  83897. "I0": [ "0" ],
  83898. "I1": [ 3841 ],
  83899. "I2": [ 2863 ],
  83900. "I3": [ 3934 ],
  83901. "O": [ 3935 ]
  83902. }
  83903. },
  83904. "cpu_I.decode_RS2_SB_LUT4_O_30_I3_SB_LUT4_O": {
  83905. "hide_name": 0,
  83906. "type": "SB_LUT4",
  83907. "parameters": {
  83908. "LUT_INIT": "0000000011110011"
  83909. },
  83910. "attributes": {
  83911. "module_not_derived": "00000000000000000000000000000001",
  83912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83913. },
  83914. "port_directions": {
  83915. "I0": "input",
  83916. "I1": "input",
  83917. "I2": "input",
  83918. "I3": "input",
  83919. "O": "output"
  83920. },
  83921. "connections": {
  83922. "I0": [ "0" ],
  83923. "I1": [ 3848 ],
  83924. "I2": [ 3256 ],
  83925. "I3": [ 3936 ],
  83926. "O": [ 3934 ]
  83927. }
  83928. },
  83929. "cpu_I.decode_RS2_SB_LUT4_O_30_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  83930. "hide_name": 0,
  83931. "type": "SB_LUT4",
  83932. "parameters": {
  83933. "LUT_INIT": "0000000101000101"
  83934. },
  83935. "attributes": {
  83936. "module_not_derived": "00000000000000000000000000000001",
  83937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  83938. },
  83939. "port_directions": {
  83940. "I0": "input",
  83941. "I1": "input",
  83942. "I2": "input",
  83943. "I3": "input",
  83944. "O": "output"
  83945. },
  83946. "connections": {
  83947. "I0": [ 3848 ],
  83948. "I1": [ 2112 ],
  83949. "I2": [ 2100 ],
  83950. "I3": [ 2282 ],
  83951. "O": [ 3936 ]
  83952. }
  83953. },
  83954. "cpu_I.decode_RS2_SB_LUT4_O_31": {
  83955. "hide_name": 0,
  83956. "type": "SB_LUT4",
  83957. "parameters": {
  83958. "LUT_INIT": "1111001111000000"
  83959. },
  83960. "attributes": {
  83961. "module_not_derived": "00000000000000000000000000000001",
  83962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83963. },
  83964. "port_directions": {
  83965. "I0": "input",
  83966. "I1": "input",
  83967. "I2": "input",
  83968. "I3": "input",
  83969. "O": "output"
  83970. },
  83971. "connections": {
  83972. "I0": [ "0" ],
  83973. "I1": [ 3841 ],
  83974. "I2": [ 3067 ],
  83975. "I3": [ 3937 ],
  83976. "O": [ 3938 ]
  83977. }
  83978. },
  83979. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O": {
  83980. "hide_name": 0,
  83981. "type": "SB_LUT4",
  83982. "parameters": {
  83983. "LUT_INIT": "0000000011110011"
  83984. },
  83985. "attributes": {
  83986. "module_not_derived": "00000000000000000000000000000001",
  83987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  83988. },
  83989. "port_directions": {
  83990. "I0": "input",
  83991. "I1": "input",
  83992. "I2": "input",
  83993. "I3": "input",
  83994. "O": "output"
  83995. },
  83996. "connections": {
  83997. "I0": [ "0" ],
  83998. "I1": [ 3848 ],
  83999. "I2": [ 3239 ],
  84000. "I3": [ 3939 ],
  84001. "O": [ 3937 ]
  84002. }
  84003. },
  84004. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84005. "hide_name": 0,
  84006. "type": "SB_LUT4",
  84007. "parameters": {
  84008. "LUT_INIT": "0000000101000101"
  84009. },
  84010. "attributes": {
  84011. "module_not_derived": "00000000000000000000000000000001",
  84012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  84013. },
  84014. "port_directions": {
  84015. "I0": "input",
  84016. "I1": "input",
  84017. "I2": "input",
  84018. "I3": "input",
  84019. "O": "output"
  84020. },
  84021. "connections": {
  84022. "I0": [ 3848 ],
  84023. "I1": [ 2112 ],
  84024. "I2": [ 3940 ],
  84025. "I3": [ 2283 ],
  84026. "O": [ 3939 ]
  84027. }
  84028. },
  84029. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  84030. "hide_name": 0,
  84031. "type": "SB_LUT4",
  84032. "parameters": {
  84033. "LUT_INIT": "1100110011110000"
  84034. },
  84035. "attributes": {
  84036. "module_not_derived": "00000000000000000000000000000001",
  84037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84038. },
  84039. "port_directions": {
  84040. "I0": "input",
  84041. "I1": "input",
  84042. "I2": "input",
  84043. "I3": "input",
  84044. "O": "output"
  84045. },
  84046. "connections": {
  84047. "I0": [ "0" ],
  84048. "I1": [ 2064 ],
  84049. "I2": [ 3941 ],
  84050. "I3": [ 2080 ],
  84051. "O": [ 3940 ]
  84052. }
  84053. },
  84054. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  84055. "hide_name": 0,
  84056. "type": "SB_LUT4",
  84057. "parameters": {
  84058. "LUT_INIT": "1111000011001100"
  84059. },
  84060. "attributes": {
  84061. "module_not_derived": "00000000000000000000000000000001",
  84062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84063. },
  84064. "port_directions": {
  84065. "I0": "input",
  84066. "I1": "input",
  84067. "I2": "input",
  84068. "I3": "input",
  84069. "O": "output"
  84070. },
  84071. "connections": {
  84072. "I0": [ "0" ],
  84073. "I1": [ 2041 ],
  84074. "I2": [ 2076 ],
  84075. "I3": [ 2078 ],
  84076. "O": [ 3941 ]
  84077. }
  84078. },
  84079. "cpu_I.decode_RS2_SB_LUT4_O_3_I3_SB_LUT4_O": {
  84080. "hide_name": 0,
  84081. "type": "SB_LUT4",
  84082. "parameters": {
  84083. "LUT_INIT": "1111001111000000"
  84084. },
  84085. "attributes": {
  84086. "module_not_derived": "00000000000000000000000000000001",
  84087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84088. },
  84089. "port_directions": {
  84090. "I0": "input",
  84091. "I1": "input",
  84092. "I2": "input",
  84093. "I3": "input",
  84094. "O": "output"
  84095. },
  84096. "connections": {
  84097. "I0": [ "0" ],
  84098. "I1": [ 3848 ],
  84099. "I2": [ 3246 ],
  84100. "I3": [ 3942 ],
  84101. "O": [ 3932 ]
  84102. }
  84103. },
  84104. "cpu_I.decode_RS2_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84105. "hide_name": 0,
  84106. "type": "SB_LUT4",
  84107. "parameters": {
  84108. "LUT_INIT": "1111001111000000"
  84109. },
  84110. "attributes": {
  84111. "module_not_derived": "00000000000000000000000000000001",
  84112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84113. },
  84114. "port_directions": {
  84115. "I0": "input",
  84116. "I1": "input",
  84117. "I2": "input",
  84118. "I3": "input",
  84119. "O": "output"
  84120. },
  84121. "connections": {
  84122. "I0": [ "0" ],
  84123. "I1": [ 2112 ],
  84124. "I2": [ 2286 ],
  84125. "I3": [ 2097 ],
  84126. "O": [ 3942 ]
  84127. }
  84128. },
  84129. "cpu_I.decode_RS2_SB_LUT4_O_4": {
  84130. "hide_name": 0,
  84131. "type": "SB_LUT4",
  84132. "parameters": {
  84133. "LUT_INIT": "1111001111000000"
  84134. },
  84135. "attributes": {
  84136. "module_not_derived": "00000000000000000000000000000001",
  84137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84138. },
  84139. "port_directions": {
  84140. "I0": "input",
  84141. "I1": "input",
  84142. "I2": "input",
  84143. "I3": "input",
  84144. "O": "output"
  84145. },
  84146. "connections": {
  84147. "I0": [ "0" ],
  84148. "I1": [ 3841 ],
  84149. "I2": [ 3025 ],
  84150. "I3": [ 3943 ],
  84151. "O": [ 3944 ]
  84152. }
  84153. },
  84154. "cpu_I.decode_RS2_SB_LUT4_O_4_I3_SB_LUT4_O": {
  84155. "hide_name": 0,
  84156. "type": "SB_LUT4",
  84157. "parameters": {
  84158. "LUT_INIT": "1111001111000000"
  84159. },
  84160. "attributes": {
  84161. "module_not_derived": "00000000000000000000000000000001",
  84162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84163. },
  84164. "port_directions": {
  84165. "I0": "input",
  84166. "I1": "input",
  84167. "I2": "input",
  84168. "I3": "input",
  84169. "O": "output"
  84170. },
  84171. "connections": {
  84172. "I0": [ "0" ],
  84173. "I1": [ 3848 ],
  84174. "I2": [ 3231 ],
  84175. "I3": [ 3945 ],
  84176. "O": [ 3943 ]
  84177. }
  84178. },
  84179. "cpu_I.decode_RS2_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84180. "hide_name": 0,
  84181. "type": "SB_LUT4",
  84182. "parameters": {
  84183. "LUT_INIT": "1111001111000000"
  84184. },
  84185. "attributes": {
  84186. "module_not_derived": "00000000000000000000000000000001",
  84187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84188. },
  84189. "port_directions": {
  84190. "I0": "input",
  84191. "I1": "input",
  84192. "I2": "input",
  84193. "I3": "input",
  84194. "O": "output"
  84195. },
  84196. "connections": {
  84197. "I0": [ "0" ],
  84198. "I1": [ 2112 ],
  84199. "I2": [ 2287 ],
  84200. "I3": [ 2122 ],
  84201. "O": [ 3945 ]
  84202. }
  84203. },
  84204. "cpu_I.decode_RS2_SB_LUT4_O_5": {
  84205. "hide_name": 0,
  84206. "type": "SB_LUT4",
  84207. "parameters": {
  84208. "LUT_INIT": "1111001111000000"
  84209. },
  84210. "attributes": {
  84211. "module_not_derived": "00000000000000000000000000000001",
  84212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84213. },
  84214. "port_directions": {
  84215. "I0": "input",
  84216. "I1": "input",
  84217. "I2": "input",
  84218. "I3": "input",
  84219. "O": "output"
  84220. },
  84221. "connections": {
  84222. "I0": [ "0" ],
  84223. "I1": [ 3841 ],
  84224. "I2": [ 3003 ],
  84225. "I3": [ 3946 ],
  84226. "O": [ 3947 ]
  84227. }
  84228. },
  84229. "cpu_I.decode_RS2_SB_LUT4_O_5_I3_SB_LUT4_O": {
  84230. "hide_name": 0,
  84231. "type": "SB_LUT4",
  84232. "parameters": {
  84233. "LUT_INIT": "1111001111000000"
  84234. },
  84235. "attributes": {
  84236. "module_not_derived": "00000000000000000000000000000001",
  84237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84238. },
  84239. "port_directions": {
  84240. "I0": "input",
  84241. "I1": "input",
  84242. "I2": "input",
  84243. "I3": "input",
  84244. "O": "output"
  84245. },
  84246. "connections": {
  84247. "I0": [ "0" ],
  84248. "I1": [ 3848 ],
  84249. "I2": [ 3164 ],
  84250. "I3": [ 3948 ],
  84251. "O": [ 3946 ]
  84252. }
  84253. },
  84254. "cpu_I.decode_RS2_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84255. "hide_name": 0,
  84256. "type": "SB_LUT4",
  84257. "parameters": {
  84258. "LUT_INIT": "1111001111000000"
  84259. },
  84260. "attributes": {
  84261. "module_not_derived": "00000000000000000000000000000001",
  84262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84263. },
  84264. "port_directions": {
  84265. "I0": "input",
  84266. "I1": "input",
  84267. "I2": "input",
  84268. "I3": "input",
  84269. "O": "output"
  84270. },
  84271. "connections": {
  84272. "I0": [ "0" ],
  84273. "I1": [ 2112 ],
  84274. "I2": [ 2288 ],
  84275. "I3": [ 2109 ],
  84276. "O": [ 3948 ]
  84277. }
  84278. },
  84279. "cpu_I.decode_RS2_SB_LUT4_O_6": {
  84280. "hide_name": 0,
  84281. "type": "SB_LUT4",
  84282. "parameters": {
  84283. "LUT_INIT": "1111001111000000"
  84284. },
  84285. "attributes": {
  84286. "module_not_derived": "00000000000000000000000000000001",
  84287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84288. },
  84289. "port_directions": {
  84290. "I0": "input",
  84291. "I1": "input",
  84292. "I2": "input",
  84293. "I3": "input",
  84294. "O": "output"
  84295. },
  84296. "connections": {
  84297. "I0": [ "0" ],
  84298. "I1": [ 3841 ],
  84299. "I2": [ 2976 ],
  84300. "I3": [ 3949 ],
  84301. "O": [ 3950 ]
  84302. }
  84303. },
  84304. "cpu_I.decode_RS2_SB_LUT4_O_6_I3_SB_LUT4_O": {
  84305. "hide_name": 0,
  84306. "type": "SB_LUT4",
  84307. "parameters": {
  84308. "LUT_INIT": "1111001111000000"
  84309. },
  84310. "attributes": {
  84311. "module_not_derived": "00000000000000000000000000000001",
  84312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84313. },
  84314. "port_directions": {
  84315. "I0": "input",
  84316. "I1": "input",
  84317. "I2": "input",
  84318. "I3": "input",
  84319. "O": "output"
  84320. },
  84321. "connections": {
  84322. "I0": [ "0" ],
  84323. "I1": [ 3848 ],
  84324. "I2": [ 3085 ],
  84325. "I3": [ 3951 ],
  84326. "O": [ 3949 ]
  84327. }
  84328. },
  84329. "cpu_I.decode_RS2_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84330. "hide_name": 0,
  84331. "type": "SB_LUT4",
  84332. "parameters": {
  84333. "LUT_INIT": "1100111111000000"
  84334. },
  84335. "attributes": {
  84336. "module_not_derived": "00000000000000000000000000000001",
  84337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84338. },
  84339. "port_directions": {
  84340. "I0": "input",
  84341. "I1": "input",
  84342. "I2": "input",
  84343. "I3": "input",
  84344. "O": "output"
  84345. },
  84346. "connections": {
  84347. "I0": [ "0" ],
  84348. "I1": [ 2289 ],
  84349. "I2": [ 2112 ],
  84350. "I3": [ 2085 ],
  84351. "O": [ 3951 ]
  84352. }
  84353. },
  84354. "cpu_I.decode_RS2_SB_LUT4_O_7": {
  84355. "hide_name": 0,
  84356. "type": "SB_LUT4",
  84357. "parameters": {
  84358. "LUT_INIT": "1111001111000000"
  84359. },
  84360. "attributes": {
  84361. "module_not_derived": "00000000000000000000000000000001",
  84362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84363. },
  84364. "port_directions": {
  84365. "I0": "input",
  84366. "I1": "input",
  84367. "I2": "input",
  84368. "I3": "input",
  84369. "O": "output"
  84370. },
  84371. "connections": {
  84372. "I0": [ "0" ],
  84373. "I1": [ 3841 ],
  84374. "I2": [ 2936 ],
  84375. "I3": [ 3952 ],
  84376. "O": [ 3953 ]
  84377. }
  84378. },
  84379. "cpu_I.decode_RS2_SB_LUT4_O_7_I3_SB_LUT4_O": {
  84380. "hide_name": 0,
  84381. "type": "SB_LUT4",
  84382. "parameters": {
  84383. "LUT_INIT": "1111001111000000"
  84384. },
  84385. "attributes": {
  84386. "module_not_derived": "00000000000000000000000000000001",
  84387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84388. },
  84389. "port_directions": {
  84390. "I0": "input",
  84391. "I1": "input",
  84392. "I2": "input",
  84393. "I3": "input",
  84394. "O": "output"
  84395. },
  84396. "connections": {
  84397. "I0": [ "0" ],
  84398. "I1": [ 3848 ],
  84399. "I2": [ 3082 ],
  84400. "I3": [ 3954 ],
  84401. "O": [ 3952 ]
  84402. }
  84403. },
  84404. "cpu_I.decode_RS2_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84405. "hide_name": 0,
  84406. "type": "SB_LUT4",
  84407. "parameters": {
  84408. "LUT_INIT": "1100111111000000"
  84409. },
  84410. "attributes": {
  84411. "module_not_derived": "00000000000000000000000000000001",
  84412. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84413. },
  84414. "port_directions": {
  84415. "I0": "input",
  84416. "I1": "input",
  84417. "I2": "input",
  84418. "I3": "input",
  84419. "O": "output"
  84420. },
  84421. "connections": {
  84422. "I0": [ "0" ],
  84423. "I1": [ 2290 ],
  84424. "I2": [ 2112 ],
  84425. "I3": [ 2103 ],
  84426. "O": [ 3954 ]
  84427. }
  84428. },
  84429. "cpu_I.decode_RS2_SB_LUT4_O_8": {
  84430. "hide_name": 0,
  84431. "type": "SB_LUT4",
  84432. "parameters": {
  84433. "LUT_INIT": "0000111100000011"
  84434. },
  84435. "attributes": {
  84436. "module_not_derived": "00000000000000000000000000000001",
  84437. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84438. },
  84439. "port_directions": {
  84440. "I0": "input",
  84441. "I1": "input",
  84442. "I2": "input",
  84443. "I3": "input",
  84444. "O": "output"
  84445. },
  84446. "connections": {
  84447. "I0": [ "0" ],
  84448. "I1": [ 3841 ],
  84449. "I2": [ 3955 ],
  84450. "I3": [ 2971 ],
  84451. "O": [ 3956 ]
  84452. }
  84453. },
  84454. "cpu_I.decode_RS2_SB_LUT4_O_8_I2_SB_LUT4_O": {
  84455. "hide_name": 0,
  84456. "type": "SB_LUT4",
  84457. "parameters": {
  84458. "LUT_INIT": "0000011100000010"
  84459. },
  84460. "attributes": {
  84461. "module_not_derived": "00000000000000000000000000000001",
  84462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  84463. },
  84464. "port_directions": {
  84465. "I0": "input",
  84466. "I1": "input",
  84467. "I2": "input",
  84468. "I3": "input",
  84469. "O": "output"
  84470. },
  84471. "connections": {
  84472. "I0": [ 3848 ],
  84473. "I1": [ 3172 ],
  84474. "I2": [ 3841 ],
  84475. "I3": [ 3957 ],
  84476. "O": [ 3955 ]
  84477. }
  84478. },
  84479. "cpu_I.decode_RS2_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  84480. "hide_name": 0,
  84481. "type": "SB_LUT4",
  84482. "parameters": {
  84483. "LUT_INIT": "0000001111001111"
  84484. },
  84485. "attributes": {
  84486. "module_not_derived": "00000000000000000000000000000001",
  84487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84488. },
  84489. "port_directions": {
  84490. "I0": "input",
  84491. "I1": "input",
  84492. "I2": "input",
  84493. "I3": "input",
  84494. "O": "output"
  84495. },
  84496. "connections": {
  84497. "I0": [ "0" ],
  84498. "I1": [ 2112 ],
  84499. "I2": [ 2190 ],
  84500. "I3": [ 2269 ],
  84501. "O": [ 3957 ]
  84502. }
  84503. },
  84504. "cpu_I.decode_RS2_SB_LUT4_O_9": {
  84505. "hide_name": 0,
  84506. "type": "SB_LUT4",
  84507. "parameters": {
  84508. "LUT_INIT": "1111110000110000"
  84509. },
  84510. "attributes": {
  84511. "module_not_derived": "00000000000000000000000000000001",
  84512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84513. },
  84514. "port_directions": {
  84515. "I0": "input",
  84516. "I1": "input",
  84517. "I2": "input",
  84518. "I3": "input",
  84519. "O": "output"
  84520. },
  84521. "connections": {
  84522. "I0": [ "0" ],
  84523. "I1": [ 3841 ],
  84524. "I2": [ 3958 ],
  84525. "I3": [ 2969 ],
  84526. "O": [ 3959 ]
  84527. }
  84528. },
  84529. "cpu_I.decode_RS2_SB_LUT4_O_9_I2_SB_LUT4_O": {
  84530. "hide_name": 0,
  84531. "type": "SB_LUT4",
  84532. "parameters": {
  84533. "LUT_INIT": "0000000011110011"
  84534. },
  84535. "attributes": {
  84536. "module_not_derived": "00000000000000000000000000000001",
  84537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84538. },
  84539. "port_directions": {
  84540. "I0": "input",
  84541. "I1": "input",
  84542. "I2": "input",
  84543. "I3": "input",
  84544. "O": "output"
  84545. },
  84546. "connections": {
  84547. "I0": [ "0" ],
  84548. "I1": [ 3848 ],
  84549. "I2": [ 3189 ],
  84550. "I3": [ 3960 ],
  84551. "O": [ 3958 ]
  84552. }
  84553. },
  84554. "cpu_I.decode_RS2_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  84555. "hide_name": 0,
  84556. "type": "SB_LUT4",
  84557. "parameters": {
  84558. "LUT_INIT": "0000000101000101"
  84559. },
  84560. "attributes": {
  84561. "module_not_derived": "00000000000000000000000000000001",
  84562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  84563. },
  84564. "port_directions": {
  84565. "I0": "input",
  84566. "I1": "input",
  84567. "I2": "input",
  84568. "I3": "input",
  84569. "O": "output"
  84570. },
  84571. "connections": {
  84572. "I0": [ 3848 ],
  84573. "I1": [ 2112 ],
  84574. "I2": [ 2184 ],
  84575. "I3": [ 2270 ],
  84576. "O": [ 3960 ]
  84577. }
  84578. },
  84579. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O": {
  84580. "hide_name": 0,
  84581. "type": "SB_LUT4",
  84582. "parameters": {
  84583. "LUT_INIT": "0011111100001100"
  84584. },
  84585. "attributes": {
  84586. "module_not_derived": "00000000000000000000000000000001",
  84587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84588. },
  84589. "port_directions": {
  84590. "I0": "input",
  84591. "I1": "input",
  84592. "I2": "input",
  84593. "I3": "input",
  84594. "O": "output"
  84595. },
  84596. "connections": {
  84597. "I0": [ "0" ],
  84598. "I1": [ 3848 ],
  84599. "I2": [ 3179 ],
  84600. "I3": [ 3961 ],
  84601. "O": [ 3842 ]
  84602. }
  84603. },
  84604. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  84605. "hide_name": 0,
  84606. "type": "SB_LUT4",
  84607. "parameters": {
  84608. "LUT_INIT": "0011111100001100"
  84609. },
  84610. "attributes": {
  84611. "module_not_derived": "00000000000000000000000000000001",
  84612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84613. },
  84614. "port_directions": {
  84615. "I0": "input",
  84616. "I1": "input",
  84617. "I2": "input",
  84618. "I3": "input",
  84619. "O": "output"
  84620. },
  84621. "connections": {
  84622. "I0": [ "0" ],
  84623. "I1": [ 2112 ],
  84624. "I2": [ 2294 ],
  84625. "I3": [ 3962 ],
  84626. "O": [ 3961 ]
  84627. }
  84628. },
  84629. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  84630. "hide_name": 0,
  84631. "type": "SB_LUT4",
  84632. "parameters": {
  84633. "LUT_INIT": "0011001111110000"
  84634. },
  84635. "attributes": {
  84636. "module_not_derived": "00000000000000000000000000000001",
  84637. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84638. },
  84639. "port_directions": {
  84640. "I0": "input",
  84641. "I1": "input",
  84642. "I2": "input",
  84643. "I3": "input",
  84644. "O": "output"
  84645. },
  84646. "connections": {
  84647. "I0": [ "0" ],
  84648. "I1": [ 2059 ],
  84649. "I2": [ 3963 ],
  84650. "I3": [ 2080 ],
  84651. "O": [ 3962 ]
  84652. }
  84653. },
  84654. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  84655. "hide_name": 0,
  84656. "type": "SB_LUT4",
  84657. "parameters": {
  84658. "LUT_INIT": "0000111100110011"
  84659. },
  84660. "attributes": {
  84661. "module_not_derived": "00000000000000000000000000000001",
  84662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84663. },
  84664. "port_directions": {
  84665. "I0": "input",
  84666. "I1": "input",
  84667. "I2": "input",
  84668. "I3": "input",
  84669. "O": "output"
  84670. },
  84671. "connections": {
  84672. "I0": [ "0" ],
  84673. "I1": [ 2036 ],
  84674. "I2": [ 2087 ],
  84675. "I3": [ 2078 ],
  84676. "O": [ 3963 ]
  84677. }
  84678. },
  84679. "cpu_I.decode_SRC2_FORCE_ZERO_SB_LUT4_O": {
  84680. "hide_name": 0,
  84681. "type": "SB_LUT4",
  84682. "parameters": {
  84683. "LUT_INIT": "0011000000000000"
  84684. },
  84685. "attributes": {
  84686. "module_not_derived": "00000000000000000000000000000001",
  84687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84688. },
  84689. "port_directions": {
  84690. "I0": "input",
  84691. "I1": "input",
  84692. "I2": "input",
  84693. "I3": "input",
  84694. "O": "output"
  84695. },
  84696. "connections": {
  84697. "I0": [ "0" ],
  84698. "I1": [ 1363 ],
  84699. "I2": [ 2328 ],
  84700. "I3": [ 2329 ],
  84701. "O": [ 3964 ]
  84702. }
  84703. },
  84704. "cpu_I.decode_SRC_USE_SUB_LESS_SB_LUT4_O": {
  84705. "hide_name": 0,
  84706. "type": "SB_LUT4",
  84707. "parameters": {
  84708. "LUT_INIT": "0000111100001100"
  84709. },
  84710. "attributes": {
  84711. "module_not_derived": "00000000000000000000000000000001",
  84712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84713. },
  84714. "port_directions": {
  84715. "I0": "input",
  84716. "I1": "input",
  84717. "I2": "input",
  84718. "I3": "input",
  84719. "O": "output"
  84720. },
  84721. "connections": {
  84722. "I0": [ "0" ],
  84723. "I1": [ 1363 ],
  84724. "I2": [ 2328 ],
  84725. "I3": [ 3965 ],
  84726. "O": [ 3966 ]
  84727. }
  84728. },
  84729. "cpu_I.decode_SRC_USE_SUB_LESS_SB_LUT4_O_I3_SB_LUT4_O": {
  84730. "hide_name": 0,
  84731. "type": "SB_LUT4",
  84732. "parameters": {
  84733. "LUT_INIT": "1110000011000000"
  84734. },
  84735. "attributes": {
  84736. "module_not_derived": "00000000000000000000000000000001",
  84737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  84738. },
  84739. "port_directions": {
  84740. "I0": "input",
  84741. "I1": "input",
  84742. "I2": "input",
  84743. "I3": "input",
  84744. "O": "output"
  84745. },
  84746. "connections": {
  84747. "I0": [ 1528 ],
  84748. "I1": [ 1537 ],
  84749. "I2": [ 1543 ],
  84750. "I3": [ 2329 ],
  84751. "O": [ 3965 ]
  84752. }
  84753. },
  84754. "cpu_I.decode_to_execute_ALU_BITWISE_CTRL_SB_DFFE_Q": {
  84755. "hide_name": 0,
  84756. "type": "SB_DFFE",
  84757. "parameters": {
  84758. },
  84759. "attributes": {
  84760. "module_not_derived": "00000000000000000000000000000001",
  84761. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  84762. },
  84763. "port_directions": {
  84764. "C": "input",
  84765. "D": "input",
  84766. "E": "input",
  84767. "Q": "output"
  84768. },
  84769. "connections": {
  84770. "C": [ 42 ],
  84771. "D": [ 3288 ],
  84772. "E": [ 2263 ],
  84773. "Q": [ 1250 ]
  84774. }
  84775. },
  84776. "cpu_I.decode_to_execute_ALU_CTRL_SB_DFFE_Q": {
  84777. "hide_name": 0,
  84778. "type": "SB_DFFE",
  84779. "parameters": {
  84780. },
  84781. "attributes": {
  84782. "module_not_derived": "00000000000000000000000000000001",
  84783. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  84784. },
  84785. "port_directions": {
  84786. "C": "input",
  84787. "D": "input",
  84788. "E": "input",
  84789. "Q": "output"
  84790. },
  84791. "connections": {
  84792. "C": [ 42 ],
  84793. "D": [ 3289 ],
  84794. "E": [ 2263 ],
  84795. "Q": [ 1246 ]
  84796. }
  84797. },
  84798. "cpu_I.decode_to_execute_ALU_CTRL_SB_DFFE_Q_1": {
  84799. "hide_name": 0,
  84800. "type": "SB_DFFE",
  84801. "parameters": {
  84802. },
  84803. "attributes": {
  84804. "module_not_derived": "00000000000000000000000000000001",
  84805. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  84806. },
  84807. "port_directions": {
  84808. "C": "input",
  84809. "D": "input",
  84810. "E": "input",
  84811. "Q": "output"
  84812. },
  84813. "connections": {
  84814. "C": [ 42 ],
  84815. "D": [ 3276 ],
  84816. "E": [ 2263 ],
  84817. "Q": [ 1247 ]
  84818. }
  84819. },
  84820. "cpu_I.decode_to_execute_BRANCH_CTRL_SB_DFFE_Q": {
  84821. "hide_name": 0,
  84822. "type": "SB_DFFE",
  84823. "parameters": {
  84824. },
  84825. "attributes": {
  84826. "module_not_derived": "00000000000000000000000000000001",
  84827. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  84828. },
  84829. "port_directions": {
  84830. "C": "input",
  84831. "D": "input",
  84832. "E": "input",
  84833. "Q": "output"
  84834. },
  84835. "connections": {
  84836. "C": [ 42 ],
  84837. "D": [ 1823 ],
  84838. "E": [ 2263 ],
  84839. "Q": [ 3967 ]
  84840. }
  84841. },
  84842. "cpu_I.decode_to_execute_BRANCH_CTRL_SB_DFFE_Q_1": {
  84843. "hide_name": 0,
  84844. "type": "SB_DFFE",
  84845. "parameters": {
  84846. },
  84847. "attributes": {
  84848. "module_not_derived": "00000000000000000000000000000001",
  84849. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  84850. },
  84851. "port_directions": {
  84852. "C": "input",
  84853. "D": "input",
  84854. "E": "input",
  84855. "Q": "output"
  84856. },
  84857. "connections": {
  84858. "C": [ 42 ],
  84859. "D": [ 1822 ],
  84860. "E": [ 2263 ],
  84861. "Q": [ 3968 ]
  84862. }
  84863. },
  84864. "cpu_I.decode_to_execute_BRANCH_CTRL_SB_LUT4_I2": {
  84865. "hide_name": 0,
  84866. "type": "SB_LUT4",
  84867. "parameters": {
  84868. "LUT_INIT": "1111000000000000"
  84869. },
  84870. "attributes": {
  84871. "module_not_derived": "00000000000000000000000000000001",
  84872. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  84873. },
  84874. "port_directions": {
  84875. "I0": "input",
  84876. "I1": "input",
  84877. "I2": "input",
  84878. "I3": "input",
  84879. "O": "output"
  84880. },
  84881. "connections": {
  84882. "I0": [ "0" ],
  84883. "I1": [ "0" ],
  84884. "I2": [ 3967 ],
  84885. "I3": [ 3968 ],
  84886. "O": [ 3969 ]
  84887. }
  84888. },
  84889. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_DFFE_Q": {
  84890. "hide_name": 0,
  84891. "type": "SB_DFFE",
  84892. "parameters": {
  84893. },
  84894. "attributes": {
  84895. "module_not_derived": "00000000000000000000000000000001",
  84896. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  84897. },
  84898. "port_directions": {
  84899. "C": "input",
  84900. "D": "input",
  84901. "E": "input",
  84902. "Q": "output"
  84903. },
  84904. "connections": {
  84905. "C": [ 42 ],
  84906. "D": [ 2333 ],
  84907. "E": [ 2263 ],
  84908. "Q": [ 3280 ]
  84909. }
  84910. },
  84911. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I0": {
  84912. "hide_name": 0,
  84913. "type": "SB_LUT4",
  84914. "parameters": {
  84915. "LUT_INIT": "0010101000111111"
  84916. },
  84917. "attributes": {
  84918. "module_not_derived": "00000000000000000000000000000001",
  84919. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  84920. },
  84921. "port_directions": {
  84922. "I0": "input",
  84923. "I1": "input",
  84924. "I2": "input",
  84925. "I3": "input",
  84926. "O": "output"
  84927. },
  84928. "connections": {
  84929. "I0": [ 3280 ],
  84930. "I1": [ 3281 ],
  84931. "I2": [ 3970 ],
  84932. "I3": [ 3971 ],
  84933. "O": [ 3278 ]
  84934. }
  84935. },
  84936. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I2": {
  84937. "hide_name": 0,
  84938. "type": "SB_LUT4",
  84939. "parameters": {
  84940. "LUT_INIT": "1111000000000000"
  84941. },
  84942. "attributes": {
  84943. "module_not_derived": "00000000000000000000000000000001",
  84944. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  84945. },
  84946. "port_directions": {
  84947. "I0": "input",
  84948. "I1": "input",
  84949. "I2": "input",
  84950. "I3": "input",
  84951. "O": "output"
  84952. },
  84953. "connections": {
  84954. "I0": [ "0" ],
  84955. "I1": [ "0" ],
  84956. "I2": [ 3280 ],
  84957. "I3": [ 3283 ],
  84958. "O": [ 3708 ]
  84959. }
  84960. },
  84961. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I2_1": {
  84962. "hide_name": 0,
  84963. "type": "SB_LUT4",
  84964. "parameters": {
  84965. "LUT_INIT": "1111000000000000"
  84966. },
  84967. "attributes": {
  84968. "module_not_derived": "00000000000000000000000000000001",
  84969. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  84970. },
  84971. "port_directions": {
  84972. "I0": "input",
  84973. "I1": "input",
  84974. "I2": "input",
  84975. "I3": "input",
  84976. "O": "output"
  84977. },
  84978. "connections": {
  84979. "I0": [ "0" ],
  84980. "I1": [ "0" ],
  84981. "I2": [ 3280 ],
  84982. "I3": [ 3971 ],
  84983. "O": [ 3841 ]
  84984. }
  84985. },
  84986. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I2_1_O_SB_LUT4_O": {
  84987. "hide_name": 0,
  84988. "type": "SB_LUT4",
  84989. "parameters": {
  84990. "LUT_INIT": "1111001111000000"
  84991. },
  84992. "attributes": {
  84993. "module_not_derived": "00000000000000000000000000000001",
  84994. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  84995. },
  84996. "port_directions": {
  84997. "I0": "input",
  84998. "I1": "input",
  84999. "I2": "input",
  85000. "I3": "input",
  85001. "O": "output"
  85002. },
  85003. "connections": {
  85004. "I0": [ "0" ],
  85005. "I1": [ 3848 ],
  85006. "I2": [ 3153 ],
  85007. "I3": [ 3972 ],
  85008. "O": [ 3865 ]
  85009. }
  85010. },
  85011. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I2_O_SB_LUT4_O": {
  85012. "hide_name": 0,
  85013. "type": "SB_LUT4",
  85014. "parameters": {
  85015. "LUT_INIT": "0011111100001100"
  85016. },
  85017. "attributes": {
  85018. "module_not_derived": "00000000000000000000000000000001",
  85019. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  85020. },
  85021. "port_directions": {
  85022. "I0": "input",
  85023. "I1": "input",
  85024. "I2": "input",
  85025. "I3": "input",
  85026. "O": "output"
  85027. },
  85028. "connections": {
  85029. "I0": [ "0" ],
  85030. "I1": [ 3715 ],
  85031. "I2": [ 3179 ],
  85032. "I3": [ 3973 ],
  85033. "O": [ 3709 ]
  85034. }
  85035. },
  85036. "cpu_I.decode_to_execute_BYPASSABLE_MEMORY_STAGE_SB_DFFE_Q": {
  85037. "hide_name": 0,
  85038. "type": "SB_DFFE",
  85039. "parameters": {
  85040. },
  85041. "attributes": {
  85042. "module_not_derived": "00000000000000000000000000000001",
  85043. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85044. },
  85045. "port_directions": {
  85046. "C": "input",
  85047. "D": "input",
  85048. "E": "input",
  85049. "Q": "output"
  85050. },
  85051. "connections": {
  85052. "C": [ 42 ],
  85053. "D": [ 2339 ],
  85054. "E": [ 2263 ],
  85055. "Q": [ 3974 ]
  85056. }
  85057. },
  85058. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_DFFE_Q": {
  85059. "hide_name": 0,
  85060. "type": "SB_DFFE",
  85061. "parameters": {
  85062. },
  85063. "attributes": {
  85064. "module_not_derived": "00000000000000000000000000000001",
  85065. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85066. },
  85067. "port_directions": {
  85068. "C": "input",
  85069. "D": "input",
  85070. "E": "input",
  85071. "Q": "output"
  85072. },
  85073. "connections": {
  85074. "C": [ 42 ],
  85075. "D": [ 3707 ],
  85076. "E": [ 2263 ],
  85077. "Q": [ 3975 ]
  85078. }
  85079. },
  85080. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0": {
  85081. "hide_name": 0,
  85082. "type": "SB_LUT4",
  85083. "parameters": {
  85084. "LUT_INIT": "0000001000000000"
  85085. },
  85086. "attributes": {
  85087. "module_not_derived": "00000000000000000000000000000001",
  85088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  85089. },
  85090. "port_directions": {
  85091. "I0": "input",
  85092. "I1": "input",
  85093. "I2": "input",
  85094. "I3": "input",
  85095. "O": "output"
  85096. },
  85097. "connections": {
  85098. "I0": [ 3975 ],
  85099. "I1": [ 2326 ],
  85100. "I2": [ 3090 ],
  85101. "I3": [ 2858 ],
  85102. "O": [ 1153 ]
  85103. }
  85104. },
  85105. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0_O_SB_LUT4_I3": {
  85106. "hide_name": 0,
  85107. "type": "SB_LUT4",
  85108. "parameters": {
  85109. "LUT_INIT": "1111000000000000"
  85110. },
  85111. "attributes": {
  85112. "module_not_derived": "00000000000000000000000000000001",
  85113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  85114. },
  85115. "port_directions": {
  85116. "I0": "input",
  85117. "I1": "input",
  85118. "I2": "input",
  85119. "I3": "input",
  85120. "O": "output"
  85121. },
  85122. "connections": {
  85123. "I0": [ "0" ],
  85124. "I1": [ "0" ],
  85125. "I2": [ 1037 ],
  85126. "I3": [ 1153 ],
  85127. "O": [ 1040 ]
  85128. }
  85129. },
  85130. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0_O_SB_LUT4_I3_1": {
  85131. "hide_name": 0,
  85132. "type": "SB_LUT4",
  85133. "parameters": {
  85134. "LUT_INIT": "1111000000000000"
  85135. },
  85136. "attributes": {
  85137. "module_not_derived": "00000000000000000000000000000001",
  85138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  85139. },
  85140. "port_directions": {
  85141. "I0": "input",
  85142. "I1": "input",
  85143. "I2": "input",
  85144. "I3": "input",
  85145. "O": "output"
  85146. },
  85147. "connections": {
  85148. "I0": [ "0" ],
  85149. "I1": [ "0" ],
  85150. "I2": [ 1043 ],
  85151. "I3": [ 1153 ],
  85152. "O": [ 2768 ]
  85153. }
  85154. },
  85155. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0_O_SB_LUT4_I3_1_O_SB_LUT4_O": {
  85156. "hide_name": 0,
  85157. "type": "SB_LUT4",
  85158. "parameters": {
  85159. "LUT_INIT": "0000111100110011"
  85160. },
  85161. "attributes": {
  85162. "module_not_derived": "00000000000000000000000000000001",
  85163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  85164. },
  85165. "port_directions": {
  85166. "I0": "input",
  85167. "I1": "input",
  85168. "I2": "input",
  85169. "I3": "input",
  85170. "O": "output"
  85171. },
  85172. "connections": {
  85173. "I0": [ "0" ],
  85174. "I1": [ 3976 ],
  85175. "I2": [ 1096 ],
  85176. "I3": [ 1052 ],
  85177. "O": [ 2834 ]
  85178. }
  85179. },
  85180. "cpu_I.decode_to_execute_ENV_CTRL_SB_DFFE_Q": {
  85181. "hide_name": 0,
  85182. "type": "SB_DFFE",
  85183. "parameters": {
  85184. },
  85185. "attributes": {
  85186. "module_not_derived": "00000000000000000000000000000001",
  85187. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85188. },
  85189. "port_directions": {
  85190. "C": "input",
  85191. "D": "input",
  85192. "E": "input",
  85193. "Q": "output"
  85194. },
  85195. "connections": {
  85196. "C": [ 42 ],
  85197. "D": [ 3286 ],
  85198. "E": [ 2263 ],
  85199. "Q": [ 1239 ]
  85200. }
  85201. },
  85202. "cpu_I.decode_to_execute_ENV_CTRL_SB_DFFE_Q_1": {
  85203. "hide_name": 0,
  85204. "type": "SB_DFFE",
  85205. "parameters": {
  85206. },
  85207. "attributes": {
  85208. "module_not_derived": "00000000000000000000000000000001",
  85209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85210. },
  85211. "port_directions": {
  85212. "C": "input",
  85213. "D": "input",
  85214. "E": "input",
  85215. "Q": "output"
  85216. },
  85217. "connections": {
  85218. "C": [ 42 ],
  85219. "D": [ 3287 ],
  85220. "E": [ 2263 ],
  85221. "Q": [ 1240 ]
  85222. }
  85223. },
  85224. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q": {
  85225. "hide_name": 0,
  85226. "type": "SB_DFFE",
  85227. "parameters": {
  85228. },
  85229. "attributes": {
  85230. "module_not_derived": "00000000000000000000000000000001",
  85231. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85232. },
  85233. "port_directions": {
  85234. "C": "input",
  85235. "D": "input",
  85236. "E": "input",
  85237. "Q": "output"
  85238. },
  85239. "connections": {
  85240. "C": [ 42 ],
  85241. "D": [ 1528 ],
  85242. "E": [ 2263 ],
  85243. "Q": [ 946 ]
  85244. }
  85245. },
  85246. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_1": {
  85247. "hide_name": 0,
  85248. "type": "SB_DFFE",
  85249. "parameters": {
  85250. },
  85251. "attributes": {
  85252. "module_not_derived": "00000000000000000000000000000001",
  85253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85254. },
  85255. "port_directions": {
  85256. "C": "input",
  85257. "D": "input",
  85258. "E": "input",
  85259. "Q": "output"
  85260. },
  85261. "connections": {
  85262. "C": [ 42 ],
  85263. "D": [ 1529 ],
  85264. "E": [ 2263 ],
  85265. "Q": [ 968 ]
  85266. }
  85267. },
  85268. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_10": {
  85269. "hide_name": 0,
  85270. "type": "SB_DFFE",
  85271. "parameters": {
  85272. },
  85273. "attributes": {
  85274. "module_not_derived": "00000000000000000000000000000001",
  85275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85276. },
  85277. "port_directions": {
  85278. "C": "input",
  85279. "D": "input",
  85280. "E": "input",
  85281. "Q": "output"
  85282. },
  85283. "connections": {
  85284. "C": [ 42 ],
  85285. "D": [ 1530 ],
  85286. "E": [ 2263 ],
  85287. "Q": [ 950 ]
  85288. }
  85289. },
  85290. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_11": {
  85291. "hide_name": 0,
  85292. "type": "SB_DFFE",
  85293. "parameters": {
  85294. },
  85295. "attributes": {
  85296. "module_not_derived": "00000000000000000000000000000001",
  85297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85298. },
  85299. "port_directions": {
  85300. "C": "input",
  85301. "D": "input",
  85302. "E": "input",
  85303. "Q": "output"
  85304. },
  85305. "connections": {
  85306. "C": [ 42 ],
  85307. "D": [ 1531 ],
  85308. "E": [ 2263 ],
  85309. "Q": [ 952 ]
  85310. }
  85311. },
  85312. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_12": {
  85313. "hide_name": 0,
  85314. "type": "SB_DFFE",
  85315. "parameters": {
  85316. },
  85317. "attributes": {
  85318. "module_not_derived": "00000000000000000000000000000001",
  85319. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85320. },
  85321. "port_directions": {
  85322. "C": "input",
  85323. "D": "input",
  85324. "E": "input",
  85325. "Q": "output"
  85326. },
  85327. "connections": {
  85328. "C": [ 42 ],
  85329. "D": [ 1532 ],
  85330. "E": [ 2263 ],
  85331. "Q": [ 954 ]
  85332. }
  85333. },
  85334. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_13": {
  85335. "hide_name": 0,
  85336. "type": "SB_DFFE",
  85337. "parameters": {
  85338. },
  85339. "attributes": {
  85340. "module_not_derived": "00000000000000000000000000000001",
  85341. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85342. },
  85343. "port_directions": {
  85344. "C": "input",
  85345. "D": "input",
  85346. "E": "input",
  85347. "Q": "output"
  85348. },
  85349. "connections": {
  85350. "C": [ 42 ],
  85351. "D": [ 1533 ],
  85352. "E": [ 2263 ],
  85353. "Q": [ 956 ]
  85354. }
  85355. },
  85356. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_14": {
  85357. "hide_name": 0,
  85358. "type": "SB_DFFE",
  85359. "parameters": {
  85360. },
  85361. "attributes": {
  85362. "module_not_derived": "00000000000000000000000000000001",
  85363. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85364. },
  85365. "port_directions": {
  85366. "C": "input",
  85367. "D": "input",
  85368. "E": "input",
  85369. "Q": "output"
  85370. },
  85371. "connections": {
  85372. "C": [ 42 ],
  85373. "D": [ 1534 ],
  85374. "E": [ 2263 ],
  85375. "Q": [ 958 ]
  85376. }
  85377. },
  85378. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_15": {
  85379. "hide_name": 0,
  85380. "type": "SB_DFFE",
  85381. "parameters": {
  85382. },
  85383. "attributes": {
  85384. "module_not_derived": "00000000000000000000000000000001",
  85385. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85386. },
  85387. "port_directions": {
  85388. "C": "input",
  85389. "D": "input",
  85390. "E": "input",
  85391. "Q": "output"
  85392. },
  85393. "connections": {
  85394. "C": [ 42 ],
  85395. "D": [ 1535 ],
  85396. "E": [ 2263 ],
  85397. "Q": [ 960 ]
  85398. }
  85399. },
  85400. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_16": {
  85401. "hide_name": 0,
  85402. "type": "SB_DFFE",
  85403. "parameters": {
  85404. },
  85405. "attributes": {
  85406. "module_not_derived": "00000000000000000000000000000001",
  85407. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85408. },
  85409. "port_directions": {
  85410. "C": "input",
  85411. "D": "input",
  85412. "E": "input",
  85413. "Q": "output"
  85414. },
  85415. "connections": {
  85416. "C": [ 42 ],
  85417. "D": [ 1536 ],
  85418. "E": [ 2263 ],
  85419. "Q": [ 962 ]
  85420. }
  85421. },
  85422. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_17": {
  85423. "hide_name": 0,
  85424. "type": "SB_DFFE",
  85425. "parameters": {
  85426. },
  85427. "attributes": {
  85428. "module_not_derived": "00000000000000000000000000000001",
  85429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85430. },
  85431. "port_directions": {
  85432. "C": "input",
  85433. "D": "input",
  85434. "E": "input",
  85435. "Q": "output"
  85436. },
  85437. "connections": {
  85438. "C": [ 42 ],
  85439. "D": [ 1362 ],
  85440. "E": [ 2263 ],
  85441. "Q": [ 966 ]
  85442. }
  85443. },
  85444. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_18": {
  85445. "hide_name": 0,
  85446. "type": "SB_DFFE",
  85447. "parameters": {
  85448. },
  85449. "attributes": {
  85450. "module_not_derived": "00000000000000000000000000000001",
  85451. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85452. },
  85453. "port_directions": {
  85454. "C": "input",
  85455. "D": "input",
  85456. "E": "input",
  85457. "Q": "output"
  85458. },
  85459. "connections": {
  85460. "C": [ 42 ],
  85461. "D": [ 1538 ],
  85462. "E": [ 2263 ],
  85463. "Q": [ 970 ]
  85464. }
  85465. },
  85466. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_19": {
  85467. "hide_name": 0,
  85468. "type": "SB_DFFE",
  85469. "parameters": {
  85470. },
  85471. "attributes": {
  85472. "module_not_derived": "00000000000000000000000000000001",
  85473. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85474. },
  85475. "port_directions": {
  85476. "C": "input",
  85477. "D": "input",
  85478. "E": "input",
  85479. "Q": "output"
  85480. },
  85481. "connections": {
  85482. "C": [ 42 ],
  85483. "D": [ 1539 ],
  85484. "E": [ 2263 ],
  85485. "Q": [ 972 ]
  85486. }
  85487. },
  85488. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_2": {
  85489. "hide_name": 0,
  85490. "type": "SB_DFFE",
  85491. "parameters": {
  85492. },
  85493. "attributes": {
  85494. "module_not_derived": "00000000000000000000000000000001",
  85495. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85496. },
  85497. "port_directions": {
  85498. "C": "input",
  85499. "D": "input",
  85500. "E": "input",
  85501. "Q": "output"
  85502. },
  85503. "connections": {
  85504. "C": [ 42 ],
  85505. "D": [ 1540 ],
  85506. "E": [ 2263 ],
  85507. "Q": [ 990 ]
  85508. }
  85509. },
  85510. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_20": {
  85511. "hide_name": 0,
  85512. "type": "SB_DFFE",
  85513. "parameters": {
  85514. },
  85515. "attributes": {
  85516. "module_not_derived": "00000000000000000000000000000001",
  85517. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85518. },
  85519. "port_directions": {
  85520. "C": "input",
  85521. "D": "input",
  85522. "E": "input",
  85523. "Q": "output"
  85524. },
  85525. "connections": {
  85526. "C": [ 42 ],
  85527. "D": [ 1541 ],
  85528. "E": [ 2263 ],
  85529. "Q": [ 974 ]
  85530. }
  85531. },
  85532. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_21": {
  85533. "hide_name": 0,
  85534. "type": "SB_DFFE",
  85535. "parameters": {
  85536. },
  85537. "attributes": {
  85538. "module_not_derived": "00000000000000000000000000000001",
  85539. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85540. },
  85541. "port_directions": {
  85542. "C": "input",
  85543. "D": "input",
  85544. "E": "input",
  85545. "Q": "output"
  85546. },
  85547. "connections": {
  85548. "C": [ 42 ],
  85549. "D": [ 1542 ],
  85550. "E": [ 2263 ],
  85551. "Q": [ 976 ]
  85552. }
  85553. },
  85554. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_22": {
  85555. "hide_name": 0,
  85556. "type": "SB_DFFE",
  85557. "parameters": {
  85558. },
  85559. "attributes": {
  85560. "module_not_derived": "00000000000000000000000000000001",
  85561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85562. },
  85563. "port_directions": {
  85564. "C": "input",
  85565. "D": "input",
  85566. "E": "input",
  85567. "Q": "output"
  85568. },
  85569. "connections": {
  85570. "C": [ 42 ],
  85571. "D": [ 1363 ],
  85572. "E": [ 2263 ],
  85573. "Q": [ 980 ]
  85574. }
  85575. },
  85576. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_23": {
  85577. "hide_name": 0,
  85578. "type": "SB_DFFE",
  85579. "parameters": {
  85580. },
  85581. "attributes": {
  85582. "module_not_derived": "00000000000000000000000000000001",
  85583. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85584. },
  85585. "port_directions": {
  85586. "C": "input",
  85587. "D": "input",
  85588. "E": "input",
  85589. "Q": "output"
  85590. },
  85591. "connections": {
  85592. "C": [ 42 ],
  85593. "D": [ 1543 ],
  85594. "E": [ 2263 ],
  85595. "Q": [ 984 ]
  85596. }
  85597. },
  85598. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_24": {
  85599. "hide_name": 0,
  85600. "type": "SB_DFFE",
  85601. "parameters": {
  85602. },
  85603. "attributes": {
  85604. "module_not_derived": "00000000000000000000000000000001",
  85605. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85606. },
  85607. "port_directions": {
  85608. "C": "input",
  85609. "D": "input",
  85610. "E": "input",
  85611. "Q": "output"
  85612. },
  85613. "connections": {
  85614. "C": [ 42 ],
  85615. "D": [ 1364 ],
  85616. "E": [ 2263 ],
  85617. "Q": [ 986 ]
  85618. }
  85619. },
  85620. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_25": {
  85621. "hide_name": 0,
  85622. "type": "SB_DFFE",
  85623. "parameters": {
  85624. },
  85625. "attributes": {
  85626. "module_not_derived": "00000000000000000000000000000001",
  85627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85628. },
  85629. "port_directions": {
  85630. "C": "input",
  85631. "D": "input",
  85632. "E": "input",
  85633. "Q": "output"
  85634. },
  85635. "connections": {
  85636. "C": [ 42 ],
  85637. "D": [ 2328 ],
  85638. "E": [ 2263 ],
  85639. "Q": [ 988 ]
  85640. }
  85641. },
  85642. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_26": {
  85643. "hide_name": 0,
  85644. "type": "SB_DFFE",
  85645. "parameters": {
  85646. },
  85647. "attributes": {
  85648. "module_not_derived": "00000000000000000000000000000001",
  85649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85650. },
  85651. "port_directions": {
  85652. "C": "input",
  85653. "D": "input",
  85654. "E": "input",
  85655. "Q": "output"
  85656. },
  85657. "connections": {
  85658. "C": [ 42 ],
  85659. "D": [ 1544 ],
  85660. "E": [ 2263 ],
  85661. "Q": [ 992 ]
  85662. }
  85663. },
  85664. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_27": {
  85665. "hide_name": 0,
  85666. "type": "SB_DFFE",
  85667. "parameters": {
  85668. },
  85669. "attributes": {
  85670. "module_not_derived": "00000000000000000000000000000001",
  85671. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85672. },
  85673. "port_directions": {
  85674. "C": "input",
  85675. "D": "input",
  85676. "E": "input",
  85677. "Q": "output"
  85678. },
  85679. "connections": {
  85680. "C": [ 42 ],
  85681. "D": [ 1545 ],
  85682. "E": [ 2263 ],
  85683. "Q": [ 994 ]
  85684. }
  85685. },
  85686. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_3": {
  85687. "hide_name": 0,
  85688. "type": "SB_DFFE",
  85689. "parameters": {
  85690. },
  85691. "attributes": {
  85692. "module_not_derived": "00000000000000000000000000000001",
  85693. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85694. },
  85695. "port_directions": {
  85696. "C": "input",
  85697. "D": "input",
  85698. "E": "input",
  85699. "Q": "output"
  85700. },
  85701. "connections": {
  85702. "C": [ 42 ],
  85703. "D": [ 1546 ],
  85704. "E": [ 2263 ],
  85705. "Q": [ 996 ]
  85706. }
  85707. },
  85708. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_4": {
  85709. "hide_name": 0,
  85710. "type": "SB_DFFE",
  85711. "parameters": {
  85712. },
  85713. "attributes": {
  85714. "module_not_derived": "00000000000000000000000000000001",
  85715. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85716. },
  85717. "port_directions": {
  85718. "C": "input",
  85719. "D": "input",
  85720. "E": "input",
  85721. "Q": "output"
  85722. },
  85723. "connections": {
  85724. "C": [ 42 ],
  85725. "D": [ 1547 ],
  85726. "E": [ 2263 ],
  85727. "Q": [ 998 ]
  85728. }
  85729. },
  85730. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_5": {
  85731. "hide_name": 0,
  85732. "type": "SB_DFFE",
  85733. "parameters": {
  85734. },
  85735. "attributes": {
  85736. "module_not_derived": "00000000000000000000000000000001",
  85737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85738. },
  85739. "port_directions": {
  85740. "C": "input",
  85741. "D": "input",
  85742. "E": "input",
  85743. "Q": "output"
  85744. },
  85745. "connections": {
  85746. "C": [ 42 ],
  85747. "D": [ 1548 ],
  85748. "E": [ 2263 ],
  85749. "Q": [ 1000 ]
  85750. }
  85751. },
  85752. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_6": {
  85753. "hide_name": 0,
  85754. "type": "SB_DFFE",
  85755. "parameters": {
  85756. },
  85757. "attributes": {
  85758. "module_not_derived": "00000000000000000000000000000001",
  85759. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85760. },
  85761. "port_directions": {
  85762. "C": "input",
  85763. "D": "input",
  85764. "E": "input",
  85765. "Q": "output"
  85766. },
  85767. "connections": {
  85768. "C": [ 42 ],
  85769. "D": [ 1549 ],
  85770. "E": [ 2263 ],
  85771. "Q": [ 1002 ]
  85772. }
  85773. },
  85774. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_7": {
  85775. "hide_name": 0,
  85776. "type": "SB_DFFE",
  85777. "parameters": {
  85778. },
  85779. "attributes": {
  85780. "module_not_derived": "00000000000000000000000000000001",
  85781. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85782. },
  85783. "port_directions": {
  85784. "C": "input",
  85785. "D": "input",
  85786. "E": "input",
  85787. "Q": "output"
  85788. },
  85789. "connections": {
  85790. "C": [ 42 ],
  85791. "D": [ 1550 ],
  85792. "E": [ 2263 ],
  85793. "Q": [ 1004 ]
  85794. }
  85795. },
  85796. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_8": {
  85797. "hide_name": 0,
  85798. "type": "SB_DFFE",
  85799. "parameters": {
  85800. },
  85801. "attributes": {
  85802. "module_not_derived": "00000000000000000000000000000001",
  85803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85804. },
  85805. "port_directions": {
  85806. "C": "input",
  85807. "D": "input",
  85808. "E": "input",
  85809. "Q": "output"
  85810. },
  85811. "connections": {
  85812. "C": [ 42 ],
  85813. "D": [ 1551 ],
  85814. "E": [ 2263 ],
  85815. "Q": [ 1006 ]
  85816. }
  85817. },
  85818. "cpu_I.decode_to_execute_INSTRUCTION_SB_DFFE_Q_9": {
  85819. "hide_name": 0,
  85820. "type": "SB_DFFE",
  85821. "parameters": {
  85822. },
  85823. "attributes": {
  85824. "module_not_derived": "00000000000000000000000000000001",
  85825. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85826. },
  85827. "port_directions": {
  85828. "C": "input",
  85829. "D": "input",
  85830. "E": "input",
  85831. "Q": "output"
  85832. },
  85833. "connections": {
  85834. "C": [ 42 ],
  85835. "D": [ 1552 ],
  85836. "E": [ 2263 ],
  85837. "Q": [ 948 ]
  85838. }
  85839. },
  85840. "cpu_I.decode_to_execute_IS_CSR_SB_DFFE_Q": {
  85841. "hide_name": 0,
  85842. "type": "SB_DFFE",
  85843. "parameters": {
  85844. },
  85845. "attributes": {
  85846. "module_not_derived": "00000000000000000000000000000001",
  85847. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  85848. },
  85849. "port_directions": {
  85850. "C": "input",
  85851. "D": "input",
  85852. "E": "input",
  85853. "Q": "output"
  85854. },
  85855. "connections": {
  85856. "C": [ 42 ],
  85857. "D": [ 2337 ],
  85858. "E": [ 2263 ],
  85859. "Q": [ 3977 ]
  85860. }
  85861. },
  85862. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2": {
  85863. "hide_name": 0,
  85864. "type": "SB_LUT4",
  85865. "parameters": {
  85866. "LUT_INIT": "1111000000000000"
  85867. },
  85868. "attributes": {
  85869. "module_not_derived": "00000000000000000000000000000001",
  85870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  85871. },
  85872. "port_directions": {
  85873. "I0": "input",
  85874. "I1": "input",
  85875. "I2": "input",
  85876. "I3": "input",
  85877. "O": "output"
  85878. },
  85879. "connections": {
  85880. "I0": [ "0" ],
  85881. "I1": [ "0" ],
  85882. "I2": [ 3977 ],
  85883. "I3": [ 1241 ],
  85884. "O": [ 2858 ]
  85885. }
  85886. },
  85887. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_I3_SB_DFFR_Q": {
  85888. "hide_name": 0,
  85889. "type": "SB_DFFR",
  85890. "parameters": {
  85891. },
  85892. "attributes": {
  85893. "module_not_derived": "00000000000000000000000000000001",
  85894. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  85895. },
  85896. "port_directions": {
  85897. "C": "input",
  85898. "D": "input",
  85899. "Q": "output",
  85900. "R": "input"
  85901. },
  85902. "connections": {
  85903. "C": [ 42 ],
  85904. "D": [ 3978 ],
  85905. "Q": [ 1241 ],
  85906. "R": [ 127 ]
  85907. }
  85908. },
  85909. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_DFFR_Q": {
  85910. "hide_name": 0,
  85911. "type": "SB_DFFR",
  85912. "parameters": {
  85913. },
  85914. "attributes": {
  85915. "module_not_derived": "00000000000000000000000000000001",
  85916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  85917. },
  85918. "port_directions": {
  85919. "C": "input",
  85920. "D": "input",
  85921. "Q": "output",
  85922. "R": "input"
  85923. },
  85924. "connections": {
  85925. "C": [ 42 ],
  85926. "D": [ 3979 ],
  85927. "Q": [ 2326 ],
  85928. "R": [ 127 ]
  85929. }
  85930. },
  85931. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_DFFR_Q_D_SB_LUT4_O": {
  85932. "hide_name": 0,
  85933. "type": "SB_LUT4",
  85934. "parameters": {
  85935. "LUT_INIT": "0000000000001100"
  85936. },
  85937. "attributes": {
  85938. "module_not_derived": "00000000000000000000000000000001",
  85939. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  85940. },
  85941. "port_directions": {
  85942. "I0": "input",
  85943. "I1": "input",
  85944. "I2": "input",
  85945. "I3": "input",
  85946. "O": "output"
  85947. },
  85948. "connections": {
  85949. "I0": [ "0" ],
  85950. "I1": [ 3090 ],
  85951. "I2": [ 1018 ],
  85952. "I3": [ 1023 ],
  85953. "O": [ 3979 ]
  85954. }
  85955. },
  85956. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_LUT4_O": {
  85957. "hide_name": 0,
  85958. "type": "SB_LUT4",
  85959. "parameters": {
  85960. "LUT_INIT": "0000000011011111"
  85961. },
  85962. "attributes": {
  85963. "module_not_derived": "00000000000000000000000000000001",
  85964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  85965. },
  85966. "port_directions": {
  85967. "I0": "input",
  85968. "I1": "input",
  85969. "I2": "input",
  85970. "I3": "input",
  85971. "O": "output"
  85972. },
  85973. "connections": {
  85974. "I0": [ 3980 ],
  85975. "I1": [ 3981 ],
  85976. "I2": [ 1241 ],
  85977. "I3": [ 1018 ],
  85978. "O": [ 3982 ]
  85979. }
  85980. },
  85981. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_DFFS_Q": {
  85982. "hide_name": 0,
  85983. "type": "SB_DFFS",
  85984. "parameters": {
  85985. },
  85986. "attributes": {
  85987. "module_not_derived": "00000000000000000000000000000001",
  85988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  85989. },
  85990. "port_directions": {
  85991. "C": "input",
  85992. "D": "input",
  85993. "Q": "output",
  85994. "S": "input"
  85995. },
  85996. "connections": {
  85997. "C": [ 42 ],
  85998. "D": [ 3983 ],
  85999. "Q": [ 3981 ],
  86000. "S": [ 127 ]
  86001. }
  86002. },
  86003. "cpu_I.decode_to_execute_IS_DIV_SB_DFFE_Q": {
  86004. "hide_name": 0,
  86005. "type": "SB_DFFE",
  86006. "parameters": {
  86007. },
  86008. "attributes": {
  86009. "module_not_derived": "00000000000000000000000000000001",
  86010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  86011. },
  86012. "port_directions": {
  86013. "C": "input",
  86014. "D": "input",
  86015. "E": "input",
  86016. "Q": "output"
  86017. },
  86018. "connections": {
  86019. "C": [ 42 ],
  86020. "D": [ 2341 ],
  86021. "E": [ 2263 ],
  86022. "Q": [ 3984 ]
  86023. }
  86024. },
  86025. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2": {
  86026. "hide_name": 0,
  86027. "type": "SB_LUT4",
  86028. "parameters": {
  86029. "LUT_INIT": "0000110011001100"
  86030. },
  86031. "attributes": {
  86032. "module_not_derived": "00000000000000000000000000000001",
  86033. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86034. },
  86035. "port_directions": {
  86036. "I0": "input",
  86037. "I1": "input",
  86038. "I2": "input",
  86039. "I3": "input",
  86040. "O": "output"
  86041. },
  86042. "connections": {
  86043. "I0": [ "0" ],
  86044. "I1": [ 2843 ],
  86045. "I2": [ 3984 ],
  86046. "I3": [ 3985 ],
  86047. "O": [ 3986 ]
  86048. }
  86049. },
  86050. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_1": {
  86051. "hide_name": 0,
  86052. "type": "SB_LUT4",
  86053. "parameters": {
  86054. "LUT_INIT": "1100000000000000"
  86055. },
  86056. "attributes": {
  86057. "module_not_derived": "00000000000000000000000000000001",
  86058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86059. },
  86060. "port_directions": {
  86061. "I0": "input",
  86062. "I1": "input",
  86063. "I2": "input",
  86064. "I3": "input",
  86065. "O": "output"
  86066. },
  86067. "connections": {
  86068. "I0": [ "0" ],
  86069. "I1": [ 2843 ],
  86070. "I2": [ 3984 ],
  86071. "I3": [ 3985 ],
  86072. "O": [ 3987 ]
  86073. }
  86074. },
  86075. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2": {
  86076. "hide_name": 0,
  86077. "type": "SB_LUT4",
  86078. "parameters": {
  86079. "LUT_INIT": "1000101110111000"
  86080. },
  86081. "attributes": {
  86082. "module_not_derived": "00000000000000000000000000000001",
  86083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86084. },
  86085. "port_directions": {
  86086. "I0": "input",
  86087. "I1": "input",
  86088. "I2": "input",
  86089. "I3": "input",
  86090. "O": "output"
  86091. },
  86092. "connections": {
  86093. "I0": [ 2680 ],
  86094. "I1": [ 1018 ],
  86095. "I2": [ 3986 ],
  86096. "I3": [ 3988 ],
  86097. "O": [ 3989 ]
  86098. }
  86099. },
  86100. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_I3_SB_CARRY_CO": {
  86101. "hide_name": 0,
  86102. "type": "SB_CARRY",
  86103. "parameters": {
  86104. },
  86105. "attributes": {
  86106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86107. },
  86108. "port_directions": {
  86109. "CI": "input",
  86110. "CO": "output",
  86111. "I0": "input",
  86112. "I1": "input"
  86113. },
  86114. "connections": {
  86115. "CI": [ 3990 ],
  86116. "CO": [ 3988 ],
  86117. "I0": [ "0" ],
  86118. "I1": [ 3991 ]
  86119. }
  86120. },
  86121. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  86122. "hide_name": 0,
  86123. "type": "SB_CARRY",
  86124. "parameters": {
  86125. },
  86126. "attributes": {
  86127. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86128. },
  86129. "port_directions": {
  86130. "CI": "input",
  86131. "CO": "output",
  86132. "I0": "input",
  86133. "I1": "input"
  86134. },
  86135. "connections": {
  86136. "CI": [ 3992 ],
  86137. "CO": [ 3990 ],
  86138. "I0": [ "0" ],
  86139. "I1": [ 3993 ]
  86140. }
  86141. },
  86142. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_I3_SB_CARRY_CO_I1_SB_LUT4_O": {
  86143. "hide_name": 0,
  86144. "type": "SB_LUT4",
  86145. "parameters": {
  86146. "LUT_INIT": "0000111111110000"
  86147. },
  86148. "attributes": {
  86149. "module_not_derived": "00000000000000000000000000000001",
  86150. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86151. },
  86152. "port_directions": {
  86153. "I0": "input",
  86154. "I1": "input",
  86155. "I2": "input",
  86156. "I3": "input",
  86157. "O": "output"
  86158. },
  86159. "connections": {
  86160. "I0": [ "0" ],
  86161. "I1": [ "0" ],
  86162. "I2": [ 2771 ],
  86163. "I3": [ 3987 ],
  86164. "O": [ 3991 ]
  86165. }
  86166. },
  86167. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O": {
  86168. "hide_name": 0,
  86169. "type": "SB_LUT4",
  86170. "parameters": {
  86171. "LUT_INIT": "1111000011001100"
  86172. },
  86173. "attributes": {
  86174. "module_not_derived": "00000000000000000000000000000001",
  86175. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86176. },
  86177. "port_directions": {
  86178. "I0": "input",
  86179. "I1": "input",
  86180. "I2": "input",
  86181. "I3": "input",
  86182. "O": "output"
  86183. },
  86184. "connections": {
  86185. "I0": [ "0" ],
  86186. "I1": [ 2720 ],
  86187. "I2": [ 3994 ],
  86188. "I3": [ 3995 ],
  86189. "O": [ 3996 ]
  86190. }
  86191. },
  86192. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1": {
  86193. "hide_name": 0,
  86194. "type": "SB_LUT4",
  86195. "parameters": {
  86196. "LUT_INIT": "1100110011110000"
  86197. },
  86198. "attributes": {
  86199. "module_not_derived": "00000000000000000000000000000001",
  86200. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86201. },
  86202. "port_directions": {
  86203. "I0": "input",
  86204. "I1": "input",
  86205. "I2": "input",
  86206. "I3": "input",
  86207. "O": "output"
  86208. },
  86209. "connections": {
  86210. "I0": [ "0" ],
  86211. "I1": [ 2718 ],
  86212. "I2": [ 3997 ],
  86213. "I3": [ 1018 ],
  86214. "O": [ 3998 ]
  86215. }
  86216. },
  86217. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10": {
  86218. "hide_name": 0,
  86219. "type": "SB_LUT4",
  86220. "parameters": {
  86221. "LUT_INIT": "1100111111000000"
  86222. },
  86223. "attributes": {
  86224. "module_not_derived": "00000000000000000000000000000001",
  86225. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86226. },
  86227. "port_directions": {
  86228. "I0": "input",
  86229. "I1": "input",
  86230. "I2": "input",
  86231. "I3": "input",
  86232. "O": "output"
  86233. },
  86234. "connections": {
  86235. "I0": [ "0" ],
  86236. "I1": [ 2663 ],
  86237. "I2": [ 1018 ],
  86238. "I3": [ 3999 ],
  86239. "O": [ 4000 ]
  86240. }
  86241. },
  86242. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_LUT4_O": {
  86243. "hide_name": 0,
  86244. "type": "SB_LUT4",
  86245. "parameters": {
  86246. "LUT_INIT": "0110100110010110"
  86247. },
  86248. "attributes": {
  86249. "module_not_derived": "00000000000000000000000000000001",
  86250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86251. },
  86252. "port_directions": {
  86253. "I0": "input",
  86254. "I1": "input",
  86255. "I2": "input",
  86256. "I3": "input",
  86257. "O": "output"
  86258. },
  86259. "connections": {
  86260. "I0": [ "0" ],
  86261. "I1": [ "0" ],
  86262. "I2": [ 3993 ],
  86263. "I3": [ 3992 ],
  86264. "O": [ 3999 ]
  86265. }
  86266. },
  86267. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86268. "hide_name": 0,
  86269. "type": "SB_LUT4",
  86270. "parameters": {
  86271. "LUT_INIT": "0000111111110000"
  86272. },
  86273. "attributes": {
  86274. "module_not_derived": "00000000000000000000000000000001",
  86275. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86276. },
  86277. "port_directions": {
  86278. "I0": "input",
  86279. "I1": "input",
  86280. "I2": "input",
  86281. "I3": "input",
  86282. "O": "output"
  86283. },
  86284. "connections": {
  86285. "I0": [ "0" ],
  86286. "I1": [ "0" ],
  86287. "I2": [ 2756 ],
  86288. "I3": [ 3987 ],
  86289. "O": [ 3993 ]
  86290. }
  86291. },
  86292. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86293. "hide_name": 0,
  86294. "type": "SB_CARRY",
  86295. "parameters": {
  86296. },
  86297. "attributes": {
  86298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86299. },
  86300. "port_directions": {
  86301. "CI": "input",
  86302. "CO": "output",
  86303. "I0": "input",
  86304. "I1": "input"
  86305. },
  86306. "connections": {
  86307. "CI": [ 4001 ],
  86308. "CO": [ 3992 ],
  86309. "I0": [ "0" ],
  86310. "I1": [ 4002 ]
  86311. }
  86312. },
  86313. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11": {
  86314. "hide_name": 0,
  86315. "type": "SB_LUT4",
  86316. "parameters": {
  86317. "LUT_INIT": "1100111111000000"
  86318. },
  86319. "attributes": {
  86320. "module_not_derived": "00000000000000000000000000000001",
  86321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86322. },
  86323. "port_directions": {
  86324. "I0": "input",
  86325. "I1": "input",
  86326. "I2": "input",
  86327. "I3": "input",
  86328. "O": "output"
  86329. },
  86330. "connections": {
  86331. "I0": [ "0" ],
  86332. "I1": [ 2651 ],
  86333. "I2": [ 1018 ],
  86334. "I3": [ 4003 ],
  86335. "O": [ 4004 ]
  86336. }
  86337. },
  86338. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_LUT4_O": {
  86339. "hide_name": 0,
  86340. "type": "SB_LUT4",
  86341. "parameters": {
  86342. "LUT_INIT": "0110100110010110"
  86343. },
  86344. "attributes": {
  86345. "module_not_derived": "00000000000000000000000000000001",
  86346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86347. },
  86348. "port_directions": {
  86349. "I0": "input",
  86350. "I1": "input",
  86351. "I2": "input",
  86352. "I3": "input",
  86353. "O": "output"
  86354. },
  86355. "connections": {
  86356. "I0": [ "0" ],
  86357. "I1": [ "0" ],
  86358. "I2": [ 4002 ],
  86359. "I3": [ 4001 ],
  86360. "O": [ 4003 ]
  86361. }
  86362. },
  86363. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86364. "hide_name": 0,
  86365. "type": "SB_LUT4",
  86366. "parameters": {
  86367. "LUT_INIT": "0000111111110000"
  86368. },
  86369. "attributes": {
  86370. "module_not_derived": "00000000000000000000000000000001",
  86371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86372. },
  86373. "port_directions": {
  86374. "I0": "input",
  86375. "I1": "input",
  86376. "I2": "input",
  86377. "I3": "input",
  86378. "O": "output"
  86379. },
  86380. "connections": {
  86381. "I0": [ "0" ],
  86382. "I1": [ "0" ],
  86383. "I2": [ 2849 ],
  86384. "I3": [ 3987 ],
  86385. "O": [ 4002 ]
  86386. }
  86387. },
  86388. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86389. "hide_name": 0,
  86390. "type": "SB_CARRY",
  86391. "parameters": {
  86392. },
  86393. "attributes": {
  86394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86395. },
  86396. "port_directions": {
  86397. "CI": "input",
  86398. "CO": "output",
  86399. "I0": "input",
  86400. "I1": "input"
  86401. },
  86402. "connections": {
  86403. "CI": [ 4005 ],
  86404. "CO": [ 4001 ],
  86405. "I0": [ "0" ],
  86406. "I1": [ 4006 ]
  86407. }
  86408. },
  86409. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12": {
  86410. "hide_name": 0,
  86411. "type": "SB_LUT4",
  86412. "parameters": {
  86413. "LUT_INIT": "1100111111000000"
  86414. },
  86415. "attributes": {
  86416. "module_not_derived": "00000000000000000000000000000001",
  86417. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86418. },
  86419. "port_directions": {
  86420. "I0": "input",
  86421. "I1": "input",
  86422. "I2": "input",
  86423. "I3": "input",
  86424. "O": "output"
  86425. },
  86426. "connections": {
  86427. "I0": [ "0" ],
  86428. "I1": [ 2646 ],
  86429. "I2": [ 1018 ],
  86430. "I3": [ 4007 ],
  86431. "O": [ 4008 ]
  86432. }
  86433. },
  86434. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_LUT4_O": {
  86435. "hide_name": 0,
  86436. "type": "SB_LUT4",
  86437. "parameters": {
  86438. "LUT_INIT": "0110100110010110"
  86439. },
  86440. "attributes": {
  86441. "module_not_derived": "00000000000000000000000000000001",
  86442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86443. },
  86444. "port_directions": {
  86445. "I0": "input",
  86446. "I1": "input",
  86447. "I2": "input",
  86448. "I3": "input",
  86449. "O": "output"
  86450. },
  86451. "connections": {
  86452. "I0": [ "0" ],
  86453. "I1": [ "0" ],
  86454. "I2": [ 4006 ],
  86455. "I3": [ 4005 ],
  86456. "O": [ 4007 ]
  86457. }
  86458. },
  86459. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86460. "hide_name": 0,
  86461. "type": "SB_LUT4",
  86462. "parameters": {
  86463. "LUT_INIT": "0000111111110000"
  86464. },
  86465. "attributes": {
  86466. "module_not_derived": "00000000000000000000000000000001",
  86467. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86468. },
  86469. "port_directions": {
  86470. "I0": "input",
  86471. "I1": "input",
  86472. "I2": "input",
  86473. "I3": "input",
  86474. "O": "output"
  86475. },
  86476. "connections": {
  86477. "I0": [ "0" ],
  86478. "I1": [ "0" ],
  86479. "I2": [ 4009 ],
  86480. "I3": [ 3987 ],
  86481. "O": [ 4006 ]
  86482. }
  86483. },
  86484. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86485. "hide_name": 0,
  86486. "type": "SB_CARRY",
  86487. "parameters": {
  86488. },
  86489. "attributes": {
  86490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86491. },
  86492. "port_directions": {
  86493. "CI": "input",
  86494. "CO": "output",
  86495. "I0": "input",
  86496. "I1": "input"
  86497. },
  86498. "connections": {
  86499. "CI": [ 4010 ],
  86500. "CO": [ 4005 ],
  86501. "I0": [ "0" ],
  86502. "I1": [ 4011 ]
  86503. }
  86504. },
  86505. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13": {
  86506. "hide_name": 0,
  86507. "type": "SB_LUT4",
  86508. "parameters": {
  86509. "LUT_INIT": "1100111111000000"
  86510. },
  86511. "attributes": {
  86512. "module_not_derived": "00000000000000000000000000000001",
  86513. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86514. },
  86515. "port_directions": {
  86516. "I0": "input",
  86517. "I1": "input",
  86518. "I2": "input",
  86519. "I3": "input",
  86520. "O": "output"
  86521. },
  86522. "connections": {
  86523. "I0": [ "0" ],
  86524. "I1": [ 2641 ],
  86525. "I2": [ 1018 ],
  86526. "I3": [ 4012 ],
  86527. "O": [ 4013 ]
  86528. }
  86529. },
  86530. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_LUT4_O": {
  86531. "hide_name": 0,
  86532. "type": "SB_LUT4",
  86533. "parameters": {
  86534. "LUT_INIT": "0110100110010110"
  86535. },
  86536. "attributes": {
  86537. "module_not_derived": "00000000000000000000000000000001",
  86538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86539. },
  86540. "port_directions": {
  86541. "I0": "input",
  86542. "I1": "input",
  86543. "I2": "input",
  86544. "I3": "input",
  86545. "O": "output"
  86546. },
  86547. "connections": {
  86548. "I0": [ "0" ],
  86549. "I1": [ "0" ],
  86550. "I2": [ 4011 ],
  86551. "I3": [ 4010 ],
  86552. "O": [ 4012 ]
  86553. }
  86554. },
  86555. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86556. "hide_name": 0,
  86557. "type": "SB_LUT4",
  86558. "parameters": {
  86559. "LUT_INIT": "0000111111110000"
  86560. },
  86561. "attributes": {
  86562. "module_not_derived": "00000000000000000000000000000001",
  86563. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86564. },
  86565. "port_directions": {
  86566. "I0": "input",
  86567. "I1": "input",
  86568. "I2": "input",
  86569. "I3": "input",
  86570. "O": "output"
  86571. },
  86572. "connections": {
  86573. "I0": [ "0" ],
  86574. "I1": [ "0" ],
  86575. "I2": [ 4014 ],
  86576. "I3": [ 3987 ],
  86577. "O": [ 4011 ]
  86578. }
  86579. },
  86580. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86581. "hide_name": 0,
  86582. "type": "SB_CARRY",
  86583. "parameters": {
  86584. },
  86585. "attributes": {
  86586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86587. },
  86588. "port_directions": {
  86589. "CI": "input",
  86590. "CO": "output",
  86591. "I0": "input",
  86592. "I1": "input"
  86593. },
  86594. "connections": {
  86595. "CI": [ 4015 ],
  86596. "CO": [ 4010 ],
  86597. "I0": [ "0" ],
  86598. "I1": [ 4016 ]
  86599. }
  86600. },
  86601. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14": {
  86602. "hide_name": 0,
  86603. "type": "SB_LUT4",
  86604. "parameters": {
  86605. "LUT_INIT": "1100111111000000"
  86606. },
  86607. "attributes": {
  86608. "module_not_derived": "00000000000000000000000000000001",
  86609. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86610. },
  86611. "port_directions": {
  86612. "I0": "input",
  86613. "I1": "input",
  86614. "I2": "input",
  86615. "I3": "input",
  86616. "O": "output"
  86617. },
  86618. "connections": {
  86619. "I0": [ "0" ],
  86620. "I1": [ 2636 ],
  86621. "I2": [ 1018 ],
  86622. "I3": [ 4017 ],
  86623. "O": [ 4018 ]
  86624. }
  86625. },
  86626. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_LUT4_O": {
  86627. "hide_name": 0,
  86628. "type": "SB_LUT4",
  86629. "parameters": {
  86630. "LUT_INIT": "0110100110010110"
  86631. },
  86632. "attributes": {
  86633. "module_not_derived": "00000000000000000000000000000001",
  86634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86635. },
  86636. "port_directions": {
  86637. "I0": "input",
  86638. "I1": "input",
  86639. "I2": "input",
  86640. "I3": "input",
  86641. "O": "output"
  86642. },
  86643. "connections": {
  86644. "I0": [ "0" ],
  86645. "I1": [ "0" ],
  86646. "I2": [ 4016 ],
  86647. "I3": [ 4015 ],
  86648. "O": [ 4017 ]
  86649. }
  86650. },
  86651. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86652. "hide_name": 0,
  86653. "type": "SB_LUT4",
  86654. "parameters": {
  86655. "LUT_INIT": "0000111111110000"
  86656. },
  86657. "attributes": {
  86658. "module_not_derived": "00000000000000000000000000000001",
  86659. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86660. },
  86661. "port_directions": {
  86662. "I0": "input",
  86663. "I1": "input",
  86664. "I2": "input",
  86665. "I3": "input",
  86666. "O": "output"
  86667. },
  86668. "connections": {
  86669. "I0": [ "0" ],
  86670. "I1": [ "0" ],
  86671. "I2": [ 4019 ],
  86672. "I3": [ 3987 ],
  86673. "O": [ 4016 ]
  86674. }
  86675. },
  86676. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86677. "hide_name": 0,
  86678. "type": "SB_CARRY",
  86679. "parameters": {
  86680. },
  86681. "attributes": {
  86682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86683. },
  86684. "port_directions": {
  86685. "CI": "input",
  86686. "CO": "output",
  86687. "I0": "input",
  86688. "I1": "input"
  86689. },
  86690. "connections": {
  86691. "CI": [ 4020 ],
  86692. "CO": [ 4015 ],
  86693. "I0": [ "0" ],
  86694. "I1": [ 4021 ]
  86695. }
  86696. },
  86697. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15": {
  86698. "hide_name": 0,
  86699. "type": "SB_LUT4",
  86700. "parameters": {
  86701. "LUT_INIT": "1100111111000000"
  86702. },
  86703. "attributes": {
  86704. "module_not_derived": "00000000000000000000000000000001",
  86705. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86706. },
  86707. "port_directions": {
  86708. "I0": "input",
  86709. "I1": "input",
  86710. "I2": "input",
  86711. "I3": "input",
  86712. "O": "output"
  86713. },
  86714. "connections": {
  86715. "I0": [ "0" ],
  86716. "I1": [ 2631 ],
  86717. "I2": [ 1018 ],
  86718. "I3": [ 4022 ],
  86719. "O": [ 4023 ]
  86720. }
  86721. },
  86722. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15_I3_SB_LUT4_O": {
  86723. "hide_name": 0,
  86724. "type": "SB_LUT4",
  86725. "parameters": {
  86726. "LUT_INIT": "0110100110010110"
  86727. },
  86728. "attributes": {
  86729. "module_not_derived": "00000000000000000000000000000001",
  86730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86731. },
  86732. "port_directions": {
  86733. "I0": "input",
  86734. "I1": "input",
  86735. "I2": "input",
  86736. "I3": "input",
  86737. "O": "output"
  86738. },
  86739. "connections": {
  86740. "I0": [ "0" ],
  86741. "I1": [ "0" ],
  86742. "I2": [ 4021 ],
  86743. "I3": [ 4020 ],
  86744. "O": [ 4022 ]
  86745. }
  86746. },
  86747. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86748. "hide_name": 0,
  86749. "type": "SB_LUT4",
  86750. "parameters": {
  86751. "LUT_INIT": "0000111111110000"
  86752. },
  86753. "attributes": {
  86754. "module_not_derived": "00000000000000000000000000000001",
  86755. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86756. },
  86757. "port_directions": {
  86758. "I0": "input",
  86759. "I1": "input",
  86760. "I2": "input",
  86761. "I3": "input",
  86762. "O": "output"
  86763. },
  86764. "connections": {
  86765. "I0": [ "0" ],
  86766. "I1": [ "0" ],
  86767. "I2": [ 2845 ],
  86768. "I3": [ 3987 ],
  86769. "O": [ 4021 ]
  86770. }
  86771. },
  86772. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86773. "hide_name": 0,
  86774. "type": "SB_CARRY",
  86775. "parameters": {
  86776. },
  86777. "attributes": {
  86778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86779. },
  86780. "port_directions": {
  86781. "CI": "input",
  86782. "CO": "output",
  86783. "I0": "input",
  86784. "I1": "input"
  86785. },
  86786. "connections": {
  86787. "CI": [ 4024 ],
  86788. "CO": [ 4020 ],
  86789. "I0": [ "0" ],
  86790. "I1": [ 4025 ]
  86791. }
  86792. },
  86793. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16": {
  86794. "hide_name": 0,
  86795. "type": "SB_LUT4",
  86796. "parameters": {
  86797. "LUT_INIT": "1100111111000000"
  86798. },
  86799. "attributes": {
  86800. "module_not_derived": "00000000000000000000000000000001",
  86801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86802. },
  86803. "port_directions": {
  86804. "I0": "input",
  86805. "I1": "input",
  86806. "I2": "input",
  86807. "I3": "input",
  86808. "O": "output"
  86809. },
  86810. "connections": {
  86811. "I0": [ "0" ],
  86812. "I1": [ 2626 ],
  86813. "I2": [ 1018 ],
  86814. "I3": [ 4026 ],
  86815. "O": [ 4027 ]
  86816. }
  86817. },
  86818. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16_I3_SB_LUT4_O": {
  86819. "hide_name": 0,
  86820. "type": "SB_LUT4",
  86821. "parameters": {
  86822. "LUT_INIT": "0110100110010110"
  86823. },
  86824. "attributes": {
  86825. "module_not_derived": "00000000000000000000000000000001",
  86826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86827. },
  86828. "port_directions": {
  86829. "I0": "input",
  86830. "I1": "input",
  86831. "I2": "input",
  86832. "I3": "input",
  86833. "O": "output"
  86834. },
  86835. "connections": {
  86836. "I0": [ "0" ],
  86837. "I1": [ "0" ],
  86838. "I2": [ 4025 ],
  86839. "I3": [ 4024 ],
  86840. "O": [ 4026 ]
  86841. }
  86842. },
  86843. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86844. "hide_name": 0,
  86845. "type": "SB_LUT4",
  86846. "parameters": {
  86847. "LUT_INIT": "0000111111110000"
  86848. },
  86849. "attributes": {
  86850. "module_not_derived": "00000000000000000000000000000001",
  86851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86852. },
  86853. "port_directions": {
  86854. "I0": "input",
  86855. "I1": "input",
  86856. "I2": "input",
  86857. "I3": "input",
  86858. "O": "output"
  86859. },
  86860. "connections": {
  86861. "I0": [ "0" ],
  86862. "I1": [ "0" ],
  86863. "I2": [ 4028 ],
  86864. "I3": [ 3987 ],
  86865. "O": [ 4025 ]
  86866. }
  86867. },
  86868. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86869. "hide_name": 0,
  86870. "type": "SB_CARRY",
  86871. "parameters": {
  86872. },
  86873. "attributes": {
  86874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86875. },
  86876. "port_directions": {
  86877. "CI": "input",
  86878. "CO": "output",
  86879. "I0": "input",
  86880. "I1": "input"
  86881. },
  86882. "connections": {
  86883. "CI": [ 4029 ],
  86884. "CO": [ 4024 ],
  86885. "I0": [ "0" ],
  86886. "I1": [ 4030 ]
  86887. }
  86888. },
  86889. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17": {
  86890. "hide_name": 0,
  86891. "type": "SB_LUT4",
  86892. "parameters": {
  86893. "LUT_INIT": "1100111111000000"
  86894. },
  86895. "attributes": {
  86896. "module_not_derived": "00000000000000000000000000000001",
  86897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86898. },
  86899. "port_directions": {
  86900. "I0": "input",
  86901. "I1": "input",
  86902. "I2": "input",
  86903. "I3": "input",
  86904. "O": "output"
  86905. },
  86906. "connections": {
  86907. "I0": [ "0" ],
  86908. "I1": [ 2621 ],
  86909. "I2": [ 1018 ],
  86910. "I3": [ 4031 ],
  86911. "O": [ 4032 ]
  86912. }
  86913. },
  86914. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17_I3_SB_LUT4_O": {
  86915. "hide_name": 0,
  86916. "type": "SB_LUT4",
  86917. "parameters": {
  86918. "LUT_INIT": "0110100110010110"
  86919. },
  86920. "attributes": {
  86921. "module_not_derived": "00000000000000000000000000000001",
  86922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  86923. },
  86924. "port_directions": {
  86925. "I0": "input",
  86926. "I1": "input",
  86927. "I2": "input",
  86928. "I3": "input",
  86929. "O": "output"
  86930. },
  86931. "connections": {
  86932. "I0": [ "0" ],
  86933. "I1": [ "0" ],
  86934. "I2": [ 4030 ],
  86935. "I3": [ 4029 ],
  86936. "O": [ 4031 ]
  86937. }
  86938. },
  86939. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  86940. "hide_name": 0,
  86941. "type": "SB_LUT4",
  86942. "parameters": {
  86943. "LUT_INIT": "0000111111110000"
  86944. },
  86945. "attributes": {
  86946. "module_not_derived": "00000000000000000000000000000001",
  86947. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  86948. },
  86949. "port_directions": {
  86950. "I0": "input",
  86951. "I1": "input",
  86952. "I2": "input",
  86953. "I3": "input",
  86954. "O": "output"
  86955. },
  86956. "connections": {
  86957. "I0": [ "0" ],
  86958. "I1": [ "0" ],
  86959. "I2": [ 4033 ],
  86960. "I3": [ 3987 ],
  86961. "O": [ 4030 ]
  86962. }
  86963. },
  86964. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  86965. "hide_name": 0,
  86966. "type": "SB_CARRY",
  86967. "parameters": {
  86968. },
  86969. "attributes": {
  86970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  86971. },
  86972. "port_directions": {
  86973. "CI": "input",
  86974. "CO": "output",
  86975. "I0": "input",
  86976. "I1": "input"
  86977. },
  86978. "connections": {
  86979. "CI": [ 4034 ],
  86980. "CO": [ 4029 ],
  86981. "I0": [ "0" ],
  86982. "I1": [ 4035 ]
  86983. }
  86984. },
  86985. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18": {
  86986. "hide_name": 0,
  86987. "type": "SB_LUT4",
  86988. "parameters": {
  86989. "LUT_INIT": "1100111111000000"
  86990. },
  86991. "attributes": {
  86992. "module_not_derived": "00000000000000000000000000000001",
  86993. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  86994. },
  86995. "port_directions": {
  86996. "I0": "input",
  86997. "I1": "input",
  86998. "I2": "input",
  86999. "I3": "input",
  87000. "O": "output"
  87001. },
  87002. "connections": {
  87003. "I0": [ "0" ],
  87004. "I1": [ 2616 ],
  87005. "I2": [ 1018 ],
  87006. "I3": [ 4036 ],
  87007. "O": [ 4037 ]
  87008. }
  87009. },
  87010. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18_I3_SB_LUT4_O": {
  87011. "hide_name": 0,
  87012. "type": "SB_LUT4",
  87013. "parameters": {
  87014. "LUT_INIT": "0110100110010110"
  87015. },
  87016. "attributes": {
  87017. "module_not_derived": "00000000000000000000000000000001",
  87018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87019. },
  87020. "port_directions": {
  87021. "I0": "input",
  87022. "I1": "input",
  87023. "I2": "input",
  87024. "I3": "input",
  87025. "O": "output"
  87026. },
  87027. "connections": {
  87028. "I0": [ "0" ],
  87029. "I1": [ "0" ],
  87030. "I2": [ 4035 ],
  87031. "I3": [ 4034 ],
  87032. "O": [ 4036 ]
  87033. }
  87034. },
  87035. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87036. "hide_name": 0,
  87037. "type": "SB_LUT4",
  87038. "parameters": {
  87039. "LUT_INIT": "0000111111110000"
  87040. },
  87041. "attributes": {
  87042. "module_not_derived": "00000000000000000000000000000001",
  87043. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87044. },
  87045. "port_directions": {
  87046. "I0": "input",
  87047. "I1": "input",
  87048. "I2": "input",
  87049. "I3": "input",
  87050. "O": "output"
  87051. },
  87052. "connections": {
  87053. "I0": [ "0" ],
  87054. "I1": [ "0" ],
  87055. "I2": [ 4038 ],
  87056. "I3": [ 3987 ],
  87057. "O": [ 4035 ]
  87058. }
  87059. },
  87060. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87061. "hide_name": 0,
  87062. "type": "SB_CARRY",
  87063. "parameters": {
  87064. },
  87065. "attributes": {
  87066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87067. },
  87068. "port_directions": {
  87069. "CI": "input",
  87070. "CO": "output",
  87071. "I0": "input",
  87072. "I1": "input"
  87073. },
  87074. "connections": {
  87075. "CI": [ 4039 ],
  87076. "CO": [ 4034 ],
  87077. "I0": [ "0" ],
  87078. "I1": [ 4040 ]
  87079. }
  87080. },
  87081. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19": {
  87082. "hide_name": 0,
  87083. "type": "SB_LUT4",
  87084. "parameters": {
  87085. "LUT_INIT": "1100111111000000"
  87086. },
  87087. "attributes": {
  87088. "module_not_derived": "00000000000000000000000000000001",
  87089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87090. },
  87091. "port_directions": {
  87092. "I0": "input",
  87093. "I1": "input",
  87094. "I2": "input",
  87095. "I3": "input",
  87096. "O": "output"
  87097. },
  87098. "connections": {
  87099. "I0": [ "0" ],
  87100. "I1": [ 2611 ],
  87101. "I2": [ 1018 ],
  87102. "I3": [ 4041 ],
  87103. "O": [ 4042 ]
  87104. }
  87105. },
  87106. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19_I3_SB_LUT4_O": {
  87107. "hide_name": 0,
  87108. "type": "SB_LUT4",
  87109. "parameters": {
  87110. "LUT_INIT": "0110100110010110"
  87111. },
  87112. "attributes": {
  87113. "module_not_derived": "00000000000000000000000000000001",
  87114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87115. },
  87116. "port_directions": {
  87117. "I0": "input",
  87118. "I1": "input",
  87119. "I2": "input",
  87120. "I3": "input",
  87121. "O": "output"
  87122. },
  87123. "connections": {
  87124. "I0": [ "0" ],
  87125. "I1": [ "0" ],
  87126. "I2": [ 4040 ],
  87127. "I3": [ 4039 ],
  87128. "O": [ 4041 ]
  87129. }
  87130. },
  87131. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87132. "hide_name": 0,
  87133. "type": "SB_LUT4",
  87134. "parameters": {
  87135. "LUT_INIT": "0000111111110000"
  87136. },
  87137. "attributes": {
  87138. "module_not_derived": "00000000000000000000000000000001",
  87139. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87140. },
  87141. "port_directions": {
  87142. "I0": "input",
  87143. "I1": "input",
  87144. "I2": "input",
  87145. "I3": "input",
  87146. "O": "output"
  87147. },
  87148. "connections": {
  87149. "I0": [ "0" ],
  87150. "I1": [ "0" ],
  87151. "I2": [ 2851 ],
  87152. "I3": [ 3987 ],
  87153. "O": [ 4040 ]
  87154. }
  87155. },
  87156. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87157. "hide_name": 0,
  87158. "type": "SB_CARRY",
  87159. "parameters": {
  87160. },
  87161. "attributes": {
  87162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87163. },
  87164. "port_directions": {
  87165. "CI": "input",
  87166. "CO": "output",
  87167. "I0": "input",
  87168. "I1": "input"
  87169. },
  87170. "connections": {
  87171. "CI": [ 4043 ],
  87172. "CO": [ 4039 ],
  87173. "I0": [ "0" ],
  87174. "I1": [ 4044 ]
  87175. }
  87176. },
  87177. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O": {
  87178. "hide_name": 0,
  87179. "type": "SB_LUT4",
  87180. "parameters": {
  87181. "LUT_INIT": "0110100110010110"
  87182. },
  87183. "attributes": {
  87184. "module_not_derived": "00000000000000000000000000000001",
  87185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87186. },
  87187. "port_directions": {
  87188. "I0": "input",
  87189. "I1": "input",
  87190. "I2": "input",
  87191. "I3": "input",
  87192. "O": "output"
  87193. },
  87194. "connections": {
  87195. "I0": [ "0" ],
  87196. "I1": [ "0" ],
  87197. "I2": [ 4045 ],
  87198. "I3": [ 4046 ],
  87199. "O": [ 3997 ]
  87200. }
  87201. },
  87202. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  87203. "hide_name": 0,
  87204. "type": "SB_LUT4",
  87205. "parameters": {
  87206. "LUT_INIT": "0000111111110000"
  87207. },
  87208. "attributes": {
  87209. "module_not_derived": "00000000000000000000000000000001",
  87210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87211. },
  87212. "port_directions": {
  87213. "I0": "input",
  87214. "I1": "input",
  87215. "I2": "input",
  87216. "I3": "input",
  87217. "O": "output"
  87218. },
  87219. "connections": {
  87220. "I0": [ "0" ],
  87221. "I1": [ "0" ],
  87222. "I2": [ 4047 ],
  87223. "I3": [ 3987 ],
  87224. "O": [ 4045 ]
  87225. }
  87226. },
  87227. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  87228. "hide_name": 0,
  87229. "type": "SB_CARRY",
  87230. "parameters": {
  87231. },
  87232. "attributes": {
  87233. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87234. },
  87235. "port_directions": {
  87236. "CI": "input",
  87237. "CO": "output",
  87238. "I0": "input",
  87239. "I1": "input"
  87240. },
  87241. "connections": {
  87242. "CI": [ 4048 ],
  87243. "CO": [ 4046 ],
  87244. "I0": [ "0" ],
  87245. "I1": [ 4049 ]
  87246. }
  87247. },
  87248. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2": {
  87249. "hide_name": 0,
  87250. "type": "SB_LUT4",
  87251. "parameters": {
  87252. "LUT_INIT": "1100110011110000"
  87253. },
  87254. "attributes": {
  87255. "module_not_derived": "00000000000000000000000000000001",
  87256. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87257. },
  87258. "port_directions": {
  87259. "I0": "input",
  87260. "I1": "input",
  87261. "I2": "input",
  87262. "I3": "input",
  87263. "O": "output"
  87264. },
  87265. "connections": {
  87266. "I0": [ "0" ],
  87267. "I1": [ 2710 ],
  87268. "I2": [ 4050 ],
  87269. "I3": [ 1018 ],
  87270. "O": [ 4051 ]
  87271. }
  87272. },
  87273. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20": {
  87274. "hide_name": 0,
  87275. "type": "SB_LUT4",
  87276. "parameters": {
  87277. "LUT_INIT": "1100111111000000"
  87278. },
  87279. "attributes": {
  87280. "module_not_derived": "00000000000000000000000000000001",
  87281. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87282. },
  87283. "port_directions": {
  87284. "I0": "input",
  87285. "I1": "input",
  87286. "I2": "input",
  87287. "I3": "input",
  87288. "O": "output"
  87289. },
  87290. "connections": {
  87291. "I0": [ "0" ],
  87292. "I1": [ 2603 ],
  87293. "I2": [ 1018 ],
  87294. "I3": [ 4052 ],
  87295. "O": [ 4053 ]
  87296. }
  87297. },
  87298. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20_I3_SB_LUT4_O": {
  87299. "hide_name": 0,
  87300. "type": "SB_LUT4",
  87301. "parameters": {
  87302. "LUT_INIT": "0110100110010110"
  87303. },
  87304. "attributes": {
  87305. "module_not_derived": "00000000000000000000000000000001",
  87306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87307. },
  87308. "port_directions": {
  87309. "I0": "input",
  87310. "I1": "input",
  87311. "I2": "input",
  87312. "I3": "input",
  87313. "O": "output"
  87314. },
  87315. "connections": {
  87316. "I0": [ "0" ],
  87317. "I1": [ "0" ],
  87318. "I2": [ 4044 ],
  87319. "I3": [ 4043 ],
  87320. "O": [ 4052 ]
  87321. }
  87322. },
  87323. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87324. "hide_name": 0,
  87325. "type": "SB_LUT4",
  87326. "parameters": {
  87327. "LUT_INIT": "0000111111110000"
  87328. },
  87329. "attributes": {
  87330. "module_not_derived": "00000000000000000000000000000001",
  87331. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87332. },
  87333. "port_directions": {
  87334. "I0": "input",
  87335. "I1": "input",
  87336. "I2": "input",
  87337. "I3": "input",
  87338. "O": "output"
  87339. },
  87340. "connections": {
  87341. "I0": [ "0" ],
  87342. "I1": [ "0" ],
  87343. "I2": [ 4054 ],
  87344. "I3": [ 3987 ],
  87345. "O": [ 4044 ]
  87346. }
  87347. },
  87348. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87349. "hide_name": 0,
  87350. "type": "SB_CARRY",
  87351. "parameters": {
  87352. },
  87353. "attributes": {
  87354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87355. },
  87356. "port_directions": {
  87357. "CI": "input",
  87358. "CO": "output",
  87359. "I0": "input",
  87360. "I1": "input"
  87361. },
  87362. "connections": {
  87363. "CI": [ 4055 ],
  87364. "CO": [ 4043 ],
  87365. "I0": [ "0" ],
  87366. "I1": [ 4056 ]
  87367. }
  87368. },
  87369. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21": {
  87370. "hide_name": 0,
  87371. "type": "SB_LUT4",
  87372. "parameters": {
  87373. "LUT_INIT": "1100111111000000"
  87374. },
  87375. "attributes": {
  87376. "module_not_derived": "00000000000000000000000000000001",
  87377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87378. },
  87379. "port_directions": {
  87380. "I0": "input",
  87381. "I1": "input",
  87382. "I2": "input",
  87383. "I3": "input",
  87384. "O": "output"
  87385. },
  87386. "connections": {
  87387. "I0": [ "0" ],
  87388. "I1": [ 2750 ],
  87389. "I2": [ 1018 ],
  87390. "I3": [ 4057 ],
  87391. "O": [ 4058 ]
  87392. }
  87393. },
  87394. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21_I3_SB_LUT4_O": {
  87395. "hide_name": 0,
  87396. "type": "SB_LUT4",
  87397. "parameters": {
  87398. "LUT_INIT": "0110100110010110"
  87399. },
  87400. "attributes": {
  87401. "module_not_derived": "00000000000000000000000000000001",
  87402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87403. },
  87404. "port_directions": {
  87405. "I0": "input",
  87406. "I1": "input",
  87407. "I2": "input",
  87408. "I3": "input",
  87409. "O": "output"
  87410. },
  87411. "connections": {
  87412. "I0": [ "0" ],
  87413. "I1": [ "0" ],
  87414. "I2": [ 4056 ],
  87415. "I3": [ 4055 ],
  87416. "O": [ 4057 ]
  87417. }
  87418. },
  87419. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87420. "hide_name": 0,
  87421. "type": "SB_LUT4",
  87422. "parameters": {
  87423. "LUT_INIT": "0000111111110000"
  87424. },
  87425. "attributes": {
  87426. "module_not_derived": "00000000000000000000000000000001",
  87427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87428. },
  87429. "port_directions": {
  87430. "I0": "input",
  87431. "I1": "input",
  87432. "I2": "input",
  87433. "I3": "input",
  87434. "O": "output"
  87435. },
  87436. "connections": {
  87437. "I0": [ "0" ],
  87438. "I1": [ "0" ],
  87439. "I2": [ 4059 ],
  87440. "I3": [ 3987 ],
  87441. "O": [ 4056 ]
  87442. }
  87443. },
  87444. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87445. "hide_name": 0,
  87446. "type": "SB_CARRY",
  87447. "parameters": {
  87448. },
  87449. "attributes": {
  87450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87451. },
  87452. "port_directions": {
  87453. "CI": "input",
  87454. "CO": "output",
  87455. "I0": "input",
  87456. "I1": "input"
  87457. },
  87458. "connections": {
  87459. "CI": [ 4060 ],
  87460. "CO": [ 4055 ],
  87461. "I0": [ "0" ],
  87462. "I1": [ 4061 ]
  87463. }
  87464. },
  87465. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22": {
  87466. "hide_name": 0,
  87467. "type": "SB_LUT4",
  87468. "parameters": {
  87469. "LUT_INIT": "1100111111000000"
  87470. },
  87471. "attributes": {
  87472. "module_not_derived": "00000000000000000000000000000001",
  87473. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87474. },
  87475. "port_directions": {
  87476. "I0": "input",
  87477. "I1": "input",
  87478. "I2": "input",
  87479. "I3": "input",
  87480. "O": "output"
  87481. },
  87482. "connections": {
  87483. "I0": [ "0" ],
  87484. "I1": [ 2747 ],
  87485. "I2": [ 1018 ],
  87486. "I3": [ 4062 ],
  87487. "O": [ 4063 ]
  87488. }
  87489. },
  87490. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22_I3_SB_LUT4_O": {
  87491. "hide_name": 0,
  87492. "type": "SB_LUT4",
  87493. "parameters": {
  87494. "LUT_INIT": "0110100110010110"
  87495. },
  87496. "attributes": {
  87497. "module_not_derived": "00000000000000000000000000000001",
  87498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87499. },
  87500. "port_directions": {
  87501. "I0": "input",
  87502. "I1": "input",
  87503. "I2": "input",
  87504. "I3": "input",
  87505. "O": "output"
  87506. },
  87507. "connections": {
  87508. "I0": [ "0" ],
  87509. "I1": [ "0" ],
  87510. "I2": [ 4061 ],
  87511. "I3": [ 4060 ],
  87512. "O": [ 4062 ]
  87513. }
  87514. },
  87515. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87516. "hide_name": 0,
  87517. "type": "SB_LUT4",
  87518. "parameters": {
  87519. "LUT_INIT": "0000111111110000"
  87520. },
  87521. "attributes": {
  87522. "module_not_derived": "00000000000000000000000000000001",
  87523. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87524. },
  87525. "port_directions": {
  87526. "I0": "input",
  87527. "I1": "input",
  87528. "I2": "input",
  87529. "I3": "input",
  87530. "O": "output"
  87531. },
  87532. "connections": {
  87533. "I0": [ "0" ],
  87534. "I1": [ "0" ],
  87535. "I2": [ 4064 ],
  87536. "I3": [ 3987 ],
  87537. "O": [ 4061 ]
  87538. }
  87539. },
  87540. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87541. "hide_name": 0,
  87542. "type": "SB_CARRY",
  87543. "parameters": {
  87544. },
  87545. "attributes": {
  87546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87547. },
  87548. "port_directions": {
  87549. "CI": "input",
  87550. "CO": "output",
  87551. "I0": "input",
  87552. "I1": "input"
  87553. },
  87554. "connections": {
  87555. "CI": [ 4065 ],
  87556. "CO": [ 4060 ],
  87557. "I0": [ "0" ],
  87558. "I1": [ 4066 ]
  87559. }
  87560. },
  87561. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23": {
  87562. "hide_name": 0,
  87563. "type": "SB_LUT4",
  87564. "parameters": {
  87565. "LUT_INIT": "1100111111000000"
  87566. },
  87567. "attributes": {
  87568. "module_not_derived": "00000000000000000000000000000001",
  87569. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87570. },
  87571. "port_directions": {
  87572. "I0": "input",
  87573. "I1": "input",
  87574. "I2": "input",
  87575. "I3": "input",
  87576. "O": "output"
  87577. },
  87578. "connections": {
  87579. "I0": [ "0" ],
  87580. "I1": [ 2742 ],
  87581. "I2": [ 1018 ],
  87582. "I3": [ 4067 ],
  87583. "O": [ 4068 ]
  87584. }
  87585. },
  87586. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23_I3_SB_LUT4_O": {
  87587. "hide_name": 0,
  87588. "type": "SB_LUT4",
  87589. "parameters": {
  87590. "LUT_INIT": "0110100110010110"
  87591. },
  87592. "attributes": {
  87593. "module_not_derived": "00000000000000000000000000000001",
  87594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87595. },
  87596. "port_directions": {
  87597. "I0": "input",
  87598. "I1": "input",
  87599. "I2": "input",
  87600. "I3": "input",
  87601. "O": "output"
  87602. },
  87603. "connections": {
  87604. "I0": [ "0" ],
  87605. "I1": [ "0" ],
  87606. "I2": [ 4066 ],
  87607. "I3": [ 4065 ],
  87608. "O": [ 4067 ]
  87609. }
  87610. },
  87611. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87612. "hide_name": 0,
  87613. "type": "SB_LUT4",
  87614. "parameters": {
  87615. "LUT_INIT": "0000111111110000"
  87616. },
  87617. "attributes": {
  87618. "module_not_derived": "00000000000000000000000000000001",
  87619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87620. },
  87621. "port_directions": {
  87622. "I0": "input",
  87623. "I1": "input",
  87624. "I2": "input",
  87625. "I3": "input",
  87626. "O": "output"
  87627. },
  87628. "connections": {
  87629. "I0": [ "0" ],
  87630. "I1": [ "0" ],
  87631. "I2": [ 4069 ],
  87632. "I3": [ 3987 ],
  87633. "O": [ 4066 ]
  87634. }
  87635. },
  87636. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87637. "hide_name": 0,
  87638. "type": "SB_CARRY",
  87639. "parameters": {
  87640. },
  87641. "attributes": {
  87642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87643. },
  87644. "port_directions": {
  87645. "CI": "input",
  87646. "CO": "output",
  87647. "I0": "input",
  87648. "I1": "input"
  87649. },
  87650. "connections": {
  87651. "CI": [ 4070 ],
  87652. "CO": [ 4065 ],
  87653. "I0": [ "0" ],
  87654. "I1": [ 4071 ]
  87655. }
  87656. },
  87657. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24": {
  87658. "hide_name": 0,
  87659. "type": "SB_LUT4",
  87660. "parameters": {
  87661. "LUT_INIT": "1100111111000000"
  87662. },
  87663. "attributes": {
  87664. "module_not_derived": "00000000000000000000000000000001",
  87665. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87666. },
  87667. "port_directions": {
  87668. "I0": "input",
  87669. "I1": "input",
  87670. "I2": "input",
  87671. "I3": "input",
  87672. "O": "output"
  87673. },
  87674. "connections": {
  87675. "I0": [ "0" ],
  87676. "I1": [ 2737 ],
  87677. "I2": [ 1018 ],
  87678. "I3": [ 4072 ],
  87679. "O": [ 4073 ]
  87680. }
  87681. },
  87682. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24_I3_SB_LUT4_O": {
  87683. "hide_name": 0,
  87684. "type": "SB_LUT4",
  87685. "parameters": {
  87686. "LUT_INIT": "0110100110010110"
  87687. },
  87688. "attributes": {
  87689. "module_not_derived": "00000000000000000000000000000001",
  87690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87691. },
  87692. "port_directions": {
  87693. "I0": "input",
  87694. "I1": "input",
  87695. "I2": "input",
  87696. "I3": "input",
  87697. "O": "output"
  87698. },
  87699. "connections": {
  87700. "I0": [ "0" ],
  87701. "I1": [ "0" ],
  87702. "I2": [ 4071 ],
  87703. "I3": [ 4070 ],
  87704. "O": [ 4072 ]
  87705. }
  87706. },
  87707. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87708. "hide_name": 0,
  87709. "type": "SB_LUT4",
  87710. "parameters": {
  87711. "LUT_INIT": "0000111111110000"
  87712. },
  87713. "attributes": {
  87714. "module_not_derived": "00000000000000000000000000000001",
  87715. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87716. },
  87717. "port_directions": {
  87718. "I0": "input",
  87719. "I1": "input",
  87720. "I2": "input",
  87721. "I3": "input",
  87722. "O": "output"
  87723. },
  87724. "connections": {
  87725. "I0": [ "0" ],
  87726. "I1": [ "0" ],
  87727. "I2": [ 4074 ],
  87728. "I3": [ 3987 ],
  87729. "O": [ 4071 ]
  87730. }
  87731. },
  87732. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87733. "hide_name": 0,
  87734. "type": "SB_CARRY",
  87735. "parameters": {
  87736. },
  87737. "attributes": {
  87738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87739. },
  87740. "port_directions": {
  87741. "CI": "input",
  87742. "CO": "output",
  87743. "I0": "input",
  87744. "I1": "input"
  87745. },
  87746. "connections": {
  87747. "CI": [ 4075 ],
  87748. "CO": [ 4070 ],
  87749. "I0": [ "0" ],
  87750. "I1": [ 4076 ]
  87751. }
  87752. },
  87753. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25": {
  87754. "hide_name": 0,
  87755. "type": "SB_LUT4",
  87756. "parameters": {
  87757. "LUT_INIT": "1100111111000000"
  87758. },
  87759. "attributes": {
  87760. "module_not_derived": "00000000000000000000000000000001",
  87761. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87762. },
  87763. "port_directions": {
  87764. "I0": "input",
  87765. "I1": "input",
  87766. "I2": "input",
  87767. "I3": "input",
  87768. "O": "output"
  87769. },
  87770. "connections": {
  87771. "I0": [ "0" ],
  87772. "I1": [ 2732 ],
  87773. "I2": [ 1018 ],
  87774. "I3": [ 4077 ],
  87775. "O": [ 4078 ]
  87776. }
  87777. },
  87778. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25_I3_SB_LUT4_O": {
  87779. "hide_name": 0,
  87780. "type": "SB_LUT4",
  87781. "parameters": {
  87782. "LUT_INIT": "0110100110010110"
  87783. },
  87784. "attributes": {
  87785. "module_not_derived": "00000000000000000000000000000001",
  87786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87787. },
  87788. "port_directions": {
  87789. "I0": "input",
  87790. "I1": "input",
  87791. "I2": "input",
  87792. "I3": "input",
  87793. "O": "output"
  87794. },
  87795. "connections": {
  87796. "I0": [ "0" ],
  87797. "I1": [ "0" ],
  87798. "I2": [ 4076 ],
  87799. "I3": [ 4075 ],
  87800. "O": [ 4077 ]
  87801. }
  87802. },
  87803. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87804. "hide_name": 0,
  87805. "type": "SB_LUT4",
  87806. "parameters": {
  87807. "LUT_INIT": "0000111111110000"
  87808. },
  87809. "attributes": {
  87810. "module_not_derived": "00000000000000000000000000000001",
  87811. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87812. },
  87813. "port_directions": {
  87814. "I0": "input",
  87815. "I1": "input",
  87816. "I2": "input",
  87817. "I3": "input",
  87818. "O": "output"
  87819. },
  87820. "connections": {
  87821. "I0": [ "0" ],
  87822. "I1": [ "0" ],
  87823. "I2": [ 4079 ],
  87824. "I3": [ 3987 ],
  87825. "O": [ 4076 ]
  87826. }
  87827. },
  87828. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87829. "hide_name": 0,
  87830. "type": "SB_CARRY",
  87831. "parameters": {
  87832. },
  87833. "attributes": {
  87834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87835. },
  87836. "port_directions": {
  87837. "CI": "input",
  87838. "CO": "output",
  87839. "I0": "input",
  87840. "I1": "input"
  87841. },
  87842. "connections": {
  87843. "CI": [ 4080 ],
  87844. "CO": [ 4075 ],
  87845. "I0": [ "0" ],
  87846. "I1": [ 4081 ]
  87847. }
  87848. },
  87849. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26": {
  87850. "hide_name": 0,
  87851. "type": "SB_LUT4",
  87852. "parameters": {
  87853. "LUT_INIT": "1100111111000000"
  87854. },
  87855. "attributes": {
  87856. "module_not_derived": "00000000000000000000000000000001",
  87857. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87858. },
  87859. "port_directions": {
  87860. "I0": "input",
  87861. "I1": "input",
  87862. "I2": "input",
  87863. "I3": "input",
  87864. "O": "output"
  87865. },
  87866. "connections": {
  87867. "I0": [ "0" ],
  87868. "I1": [ 2727 ],
  87869. "I2": [ 1018 ],
  87870. "I3": [ 4082 ],
  87871. "O": [ 4083 ]
  87872. }
  87873. },
  87874. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26_I3_SB_LUT4_O": {
  87875. "hide_name": 0,
  87876. "type": "SB_LUT4",
  87877. "parameters": {
  87878. "LUT_INIT": "0110100110010110"
  87879. },
  87880. "attributes": {
  87881. "module_not_derived": "00000000000000000000000000000001",
  87882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87883. },
  87884. "port_directions": {
  87885. "I0": "input",
  87886. "I1": "input",
  87887. "I2": "input",
  87888. "I3": "input",
  87889. "O": "output"
  87890. },
  87891. "connections": {
  87892. "I0": [ "0" ],
  87893. "I1": [ "0" ],
  87894. "I2": [ 4081 ],
  87895. "I3": [ 4080 ],
  87896. "O": [ 4082 ]
  87897. }
  87898. },
  87899. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  87900. "hide_name": 0,
  87901. "type": "SB_LUT4",
  87902. "parameters": {
  87903. "LUT_INIT": "0000111111110000"
  87904. },
  87905. "attributes": {
  87906. "module_not_derived": "00000000000000000000000000000001",
  87907. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  87908. },
  87909. "port_directions": {
  87910. "I0": "input",
  87911. "I1": "input",
  87912. "I2": "input",
  87913. "I3": "input",
  87914. "O": "output"
  87915. },
  87916. "connections": {
  87917. "I0": [ "0" ],
  87918. "I1": [ "0" ],
  87919. "I2": [ 4084 ],
  87920. "I3": [ 3987 ],
  87921. "O": [ 4081 ]
  87922. }
  87923. },
  87924. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  87925. "hide_name": 0,
  87926. "type": "SB_CARRY",
  87927. "parameters": {
  87928. },
  87929. "attributes": {
  87930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  87931. },
  87932. "port_directions": {
  87933. "CI": "input",
  87934. "CO": "output",
  87935. "I0": "input",
  87936. "I1": "input"
  87937. },
  87938. "connections": {
  87939. "CI": [ 4085 ],
  87940. "CO": [ 4080 ],
  87941. "I0": [ "0" ],
  87942. "I1": [ 4086 ]
  87943. }
  87944. },
  87945. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27": {
  87946. "hide_name": 0,
  87947. "type": "SB_LUT4",
  87948. "parameters": {
  87949. "LUT_INIT": "1100110011110000"
  87950. },
  87951. "attributes": {
  87952. "module_not_derived": "00000000000000000000000000000001",
  87953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  87954. },
  87955. "port_directions": {
  87956. "I0": "input",
  87957. "I1": "input",
  87958. "I2": "input",
  87959. "I3": "input",
  87960. "O": "output"
  87961. },
  87962. "connections": {
  87963. "I0": [ "0" ],
  87964. "I1": [ 2722 ],
  87965. "I2": [ 4087 ],
  87966. "I3": [ 1018 ],
  87967. "O": [ 4088 ]
  87968. }
  87969. },
  87970. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27_I2_SB_LUT4_O": {
  87971. "hide_name": 0,
  87972. "type": "SB_LUT4",
  87973. "parameters": {
  87974. "LUT_INIT": "0110100110010110"
  87975. },
  87976. "attributes": {
  87977. "module_not_derived": "00000000000000000000000000000001",
  87978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  87979. },
  87980. "port_directions": {
  87981. "I0": "input",
  87982. "I1": "input",
  87983. "I2": "input",
  87984. "I3": "input",
  87985. "O": "output"
  87986. },
  87987. "connections": {
  87988. "I0": [ "0" ],
  87989. "I1": [ "0" ],
  87990. "I2": [ 4086 ],
  87991. "I3": [ 4085 ],
  87992. "O": [ 4087 ]
  87993. }
  87994. },
  87995. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  87996. "hide_name": 0,
  87997. "type": "SB_LUT4",
  87998. "parameters": {
  87999. "LUT_INIT": "0000111111110000"
  88000. },
  88001. "attributes": {
  88002. "module_not_derived": "00000000000000000000000000000001",
  88003. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88004. },
  88005. "port_directions": {
  88006. "I0": "input",
  88007. "I1": "input",
  88008. "I2": "input",
  88009. "I3": "input",
  88010. "O": "output"
  88011. },
  88012. "connections": {
  88013. "I0": [ "0" ],
  88014. "I1": [ "0" ],
  88015. "I2": [ 4089 ],
  88016. "I3": [ 3987 ],
  88017. "O": [ 4086 ]
  88018. }
  88019. },
  88020. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88021. "hide_name": 0,
  88022. "type": "SB_CARRY",
  88023. "parameters": {
  88024. },
  88025. "attributes": {
  88026. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88027. },
  88028. "port_directions": {
  88029. "CI": "input",
  88030. "CO": "output",
  88031. "I0": "input",
  88032. "I1": "input"
  88033. },
  88034. "connections": {
  88035. "CI": [ 4090 ],
  88036. "CO": [ 4085 ],
  88037. "I0": [ "0" ],
  88038. "I1": [ 4091 ]
  88039. }
  88040. },
  88041. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28": {
  88042. "hide_name": 0,
  88043. "type": "SB_LUT4",
  88044. "parameters": {
  88045. "LUT_INIT": "1100110011110000"
  88046. },
  88047. "attributes": {
  88048. "module_not_derived": "00000000000000000000000000000001",
  88049. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88050. },
  88051. "port_directions": {
  88052. "I0": "input",
  88053. "I1": "input",
  88054. "I2": "input",
  88055. "I3": "input",
  88056. "O": "output"
  88057. },
  88058. "connections": {
  88059. "I0": [ "0" ],
  88060. "I1": [ 2712 ],
  88061. "I2": [ 4092 ],
  88062. "I3": [ 1018 ],
  88063. "O": [ 4093 ]
  88064. }
  88065. },
  88066. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28_I2_SB_LUT4_O": {
  88067. "hide_name": 0,
  88068. "type": "SB_LUT4",
  88069. "parameters": {
  88070. "LUT_INIT": "0110100110010110"
  88071. },
  88072. "attributes": {
  88073. "module_not_derived": "00000000000000000000000000000001",
  88074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88075. },
  88076. "port_directions": {
  88077. "I0": "input",
  88078. "I1": "input",
  88079. "I2": "input",
  88080. "I3": "input",
  88081. "O": "output"
  88082. },
  88083. "connections": {
  88084. "I0": [ "0" ],
  88085. "I1": [ "0" ],
  88086. "I2": [ 4091 ],
  88087. "I3": [ 4090 ],
  88088. "O": [ 4092 ]
  88089. }
  88090. },
  88091. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88092. "hide_name": 0,
  88093. "type": "SB_LUT4",
  88094. "parameters": {
  88095. "LUT_INIT": "0000111111110000"
  88096. },
  88097. "attributes": {
  88098. "module_not_derived": "00000000000000000000000000000001",
  88099. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88100. },
  88101. "port_directions": {
  88102. "I0": "input",
  88103. "I1": "input",
  88104. "I2": "input",
  88105. "I3": "input",
  88106. "O": "output"
  88107. },
  88108. "connections": {
  88109. "I0": [ "0" ],
  88110. "I1": [ "0" ],
  88111. "I2": [ 2852 ],
  88112. "I3": [ 3987 ],
  88113. "O": [ 4091 ]
  88114. }
  88115. },
  88116. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88117. "hide_name": 0,
  88118. "type": "SB_CARRY",
  88119. "parameters": {
  88120. },
  88121. "attributes": {
  88122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88123. },
  88124. "port_directions": {
  88125. "CI": "input",
  88126. "CO": "output",
  88127. "I0": "input",
  88128. "I1": "input"
  88129. },
  88130. "connections": {
  88131. "CI": [ 4094 ],
  88132. "CO": [ 4090 ],
  88133. "I0": [ "0" ],
  88134. "I1": [ 4095 ]
  88135. }
  88136. },
  88137. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29": {
  88138. "hide_name": 0,
  88139. "type": "SB_LUT4",
  88140. "parameters": {
  88141. "LUT_INIT": "1100110011110000"
  88142. },
  88143. "attributes": {
  88144. "module_not_derived": "00000000000000000000000000000001",
  88145. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88146. },
  88147. "port_directions": {
  88148. "I0": "input",
  88149. "I1": "input",
  88150. "I2": "input",
  88151. "I3": "input",
  88152. "O": "output"
  88153. },
  88154. "connections": {
  88155. "I0": [ "0" ],
  88156. "I1": [ 2653 ],
  88157. "I2": [ 4096 ],
  88158. "I3": [ 1018 ],
  88159. "O": [ 4097 ]
  88160. }
  88161. },
  88162. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29_I2_SB_LUT4_O": {
  88163. "hide_name": 0,
  88164. "type": "SB_LUT4",
  88165. "parameters": {
  88166. "LUT_INIT": "0110100110010110"
  88167. },
  88168. "attributes": {
  88169. "module_not_derived": "00000000000000000000000000000001",
  88170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88171. },
  88172. "port_directions": {
  88173. "I0": "input",
  88174. "I1": "input",
  88175. "I2": "input",
  88176. "I3": "input",
  88177. "O": "output"
  88178. },
  88179. "connections": {
  88180. "I0": [ "0" ],
  88181. "I1": [ "0" ],
  88182. "I2": [ 4095 ],
  88183. "I3": [ 4094 ],
  88184. "O": [ 4096 ]
  88185. }
  88186. },
  88187. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88188. "hide_name": 0,
  88189. "type": "SB_LUT4",
  88190. "parameters": {
  88191. "LUT_INIT": "0000111111110000"
  88192. },
  88193. "attributes": {
  88194. "module_not_derived": "00000000000000000000000000000001",
  88195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88196. },
  88197. "port_directions": {
  88198. "I0": "input",
  88199. "I1": "input",
  88200. "I2": "input",
  88201. "I3": "input",
  88202. "O": "output"
  88203. },
  88204. "connections": {
  88205. "I0": [ "0" ],
  88206. "I1": [ "0" ],
  88207. "I2": [ 4098 ],
  88208. "I3": [ 3987 ],
  88209. "O": [ 4095 ]
  88210. }
  88211. },
  88212. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88213. "hide_name": 0,
  88214. "type": "SB_CARRY",
  88215. "parameters": {
  88216. },
  88217. "attributes": {
  88218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88219. },
  88220. "port_directions": {
  88221. "CI": "input",
  88222. "CO": "output",
  88223. "I0": "input",
  88224. "I1": "input"
  88225. },
  88226. "connections": {
  88227. "CI": [ 4046 ],
  88228. "CO": [ 4094 ],
  88229. "I0": [ "0" ],
  88230. "I1": [ 4045 ]
  88231. }
  88232. },
  88233. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O": {
  88234. "hide_name": 0,
  88235. "type": "SB_LUT4",
  88236. "parameters": {
  88237. "LUT_INIT": "0110100110010110"
  88238. },
  88239. "attributes": {
  88240. "module_not_derived": "00000000000000000000000000000001",
  88241. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88242. },
  88243. "port_directions": {
  88244. "I0": "input",
  88245. "I1": "input",
  88246. "I2": "input",
  88247. "I3": "input",
  88248. "O": "output"
  88249. },
  88250. "connections": {
  88251. "I0": [ "0" ],
  88252. "I1": [ "0" ],
  88253. "I2": [ 4049 ],
  88254. "I3": [ 4048 ],
  88255. "O": [ 4050 ]
  88256. }
  88257. },
  88258. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88259. "hide_name": 0,
  88260. "type": "SB_LUT4",
  88261. "parameters": {
  88262. "LUT_INIT": "0000111111110000"
  88263. },
  88264. "attributes": {
  88265. "module_not_derived": "00000000000000000000000000000001",
  88266. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88267. },
  88268. "port_directions": {
  88269. "I0": "input",
  88270. "I1": "input",
  88271. "I2": "input",
  88272. "I3": "input",
  88273. "O": "output"
  88274. },
  88275. "connections": {
  88276. "I0": [ "0" ],
  88277. "I1": [ "0" ],
  88278. "I2": [ 4099 ],
  88279. "I3": [ 3987 ],
  88280. "O": [ 4049 ]
  88281. }
  88282. },
  88283. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88284. "hide_name": 0,
  88285. "type": "SB_CARRY",
  88286. "parameters": {
  88287. },
  88288. "attributes": {
  88289. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88290. },
  88291. "port_directions": {
  88292. "CI": "input",
  88293. "CO": "output",
  88294. "I0": "input",
  88295. "I1": "input"
  88296. },
  88297. "connections": {
  88298. "CI": [ 4100 ],
  88299. "CO": [ 4048 ],
  88300. "I0": [ "0" ],
  88301. "I1": [ 4101 ]
  88302. }
  88303. },
  88304. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3": {
  88305. "hide_name": 0,
  88306. "type": "SB_LUT4",
  88307. "parameters": {
  88308. "LUT_INIT": "1100110011110000"
  88309. },
  88310. "attributes": {
  88311. "module_not_derived": "00000000000000000000000000000001",
  88312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88313. },
  88314. "port_directions": {
  88315. "I0": "input",
  88316. "I1": "input",
  88317. "I2": "input",
  88318. "I3": "input",
  88319. "O": "output"
  88320. },
  88321. "connections": {
  88322. "I0": [ "0" ],
  88323. "I1": [ 2705 ],
  88324. "I2": [ 4102 ],
  88325. "I3": [ 1018 ],
  88326. "O": [ 4103 ]
  88327. }
  88328. },
  88329. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_30": {
  88330. "hide_name": 0,
  88331. "type": "SB_LUT4",
  88332. "parameters": {
  88333. "LUT_INIT": "0000110011111100"
  88334. },
  88335. "attributes": {
  88336. "module_not_derived": "00000000000000000000000000000001",
  88337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88338. },
  88339. "port_directions": {
  88340. "I0": "input",
  88341. "I1": "input",
  88342. "I2": "input",
  88343. "I3": "input",
  88344. "O": "output"
  88345. },
  88346. "connections": {
  88347. "I0": [ "0" ],
  88348. "I1": [ 2842 ],
  88349. "I2": [ 1018 ],
  88350. "I3": [ 4104 ],
  88351. "O": [ 4105 ]
  88352. }
  88353. },
  88354. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3_I2_SB_LUT4_O": {
  88355. "hide_name": 0,
  88356. "type": "SB_LUT4",
  88357. "parameters": {
  88358. "LUT_INIT": "0110100110010110"
  88359. },
  88360. "attributes": {
  88361. "module_not_derived": "00000000000000000000000000000001",
  88362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88363. },
  88364. "port_directions": {
  88365. "I0": "input",
  88366. "I1": "input",
  88367. "I2": "input",
  88368. "I3": "input",
  88369. "O": "output"
  88370. },
  88371. "connections": {
  88372. "I0": [ "0" ],
  88373. "I1": [ "0" ],
  88374. "I2": [ 4101 ],
  88375. "I3": [ 4100 ],
  88376. "O": [ 4102 ]
  88377. }
  88378. },
  88379. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88380. "hide_name": 0,
  88381. "type": "SB_LUT4",
  88382. "parameters": {
  88383. "LUT_INIT": "0000111111110000"
  88384. },
  88385. "attributes": {
  88386. "module_not_derived": "00000000000000000000000000000001",
  88387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88388. },
  88389. "port_directions": {
  88390. "I0": "input",
  88391. "I1": "input",
  88392. "I2": "input",
  88393. "I3": "input",
  88394. "O": "output"
  88395. },
  88396. "connections": {
  88397. "I0": [ "0" ],
  88398. "I1": [ "0" ],
  88399. "I2": [ 2846 ],
  88400. "I3": [ 3987 ],
  88401. "O": [ 4101 ]
  88402. }
  88403. },
  88404. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88405. "hide_name": 0,
  88406. "type": "SB_CARRY",
  88407. "parameters": {
  88408. },
  88409. "attributes": {
  88410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88411. },
  88412. "port_directions": {
  88413. "CI": "input",
  88414. "CO": "output",
  88415. "I0": "input",
  88416. "I1": "input"
  88417. },
  88418. "connections": {
  88419. "CI": [ 4106 ],
  88420. "CO": [ 4100 ],
  88421. "I0": [ "0" ],
  88422. "I1": [ 4107 ]
  88423. }
  88424. },
  88425. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4": {
  88426. "hide_name": 0,
  88427. "type": "SB_LUT4",
  88428. "parameters": {
  88429. "LUT_INIT": "1100110011110000"
  88430. },
  88431. "attributes": {
  88432. "module_not_derived": "00000000000000000000000000000001",
  88433. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88434. },
  88435. "port_directions": {
  88436. "I0": "input",
  88437. "I1": "input",
  88438. "I2": "input",
  88439. "I3": "input",
  88440. "O": "output"
  88441. },
  88442. "connections": {
  88443. "I0": [ "0" ],
  88444. "I1": [ 2700 ],
  88445. "I2": [ 4108 ],
  88446. "I3": [ 1018 ],
  88447. "O": [ 4109 ]
  88448. }
  88449. },
  88450. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4_I2_SB_LUT4_O": {
  88451. "hide_name": 0,
  88452. "type": "SB_LUT4",
  88453. "parameters": {
  88454. "LUT_INIT": "0110100110010110"
  88455. },
  88456. "attributes": {
  88457. "module_not_derived": "00000000000000000000000000000001",
  88458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88459. },
  88460. "port_directions": {
  88461. "I0": "input",
  88462. "I1": "input",
  88463. "I2": "input",
  88464. "I3": "input",
  88465. "O": "output"
  88466. },
  88467. "connections": {
  88468. "I0": [ "0" ],
  88469. "I1": [ "0" ],
  88470. "I2": [ 4107 ],
  88471. "I3": [ 4106 ],
  88472. "O": [ 4108 ]
  88473. }
  88474. },
  88475. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88476. "hide_name": 0,
  88477. "type": "SB_LUT4",
  88478. "parameters": {
  88479. "LUT_INIT": "0000111111110000"
  88480. },
  88481. "attributes": {
  88482. "module_not_derived": "00000000000000000000000000000001",
  88483. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88484. },
  88485. "port_directions": {
  88486. "I0": "input",
  88487. "I1": "input",
  88488. "I2": "input",
  88489. "I3": "input",
  88490. "O": "output"
  88491. },
  88492. "connections": {
  88493. "I0": [ "0" ],
  88494. "I1": [ "0" ],
  88495. "I2": [ 4110 ],
  88496. "I3": [ 3987 ],
  88497. "O": [ 4107 ]
  88498. }
  88499. },
  88500. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88501. "hide_name": 0,
  88502. "type": "SB_CARRY",
  88503. "parameters": {
  88504. },
  88505. "attributes": {
  88506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88507. },
  88508. "port_directions": {
  88509. "CI": "input",
  88510. "CO": "output",
  88511. "I0": "input",
  88512. "I1": "input"
  88513. },
  88514. "connections": {
  88515. "CI": [ 4111 ],
  88516. "CO": [ 4106 ],
  88517. "I0": [ "0" ],
  88518. "I1": [ 4112 ]
  88519. }
  88520. },
  88521. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5": {
  88522. "hide_name": 0,
  88523. "type": "SB_LUT4",
  88524. "parameters": {
  88525. "LUT_INIT": "1100110011110000"
  88526. },
  88527. "attributes": {
  88528. "module_not_derived": "00000000000000000000000000000001",
  88529. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88530. },
  88531. "port_directions": {
  88532. "I0": "input",
  88533. "I1": "input",
  88534. "I2": "input",
  88535. "I3": "input",
  88536. "O": "output"
  88537. },
  88538. "connections": {
  88539. "I0": [ "0" ],
  88540. "I1": [ 2695 ],
  88541. "I2": [ 4113 ],
  88542. "I3": [ 1018 ],
  88543. "O": [ 4114 ]
  88544. }
  88545. },
  88546. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5_I2_SB_LUT4_O": {
  88547. "hide_name": 0,
  88548. "type": "SB_LUT4",
  88549. "parameters": {
  88550. "LUT_INIT": "0110100110010110"
  88551. },
  88552. "attributes": {
  88553. "module_not_derived": "00000000000000000000000000000001",
  88554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88555. },
  88556. "port_directions": {
  88557. "I0": "input",
  88558. "I1": "input",
  88559. "I2": "input",
  88560. "I3": "input",
  88561. "O": "output"
  88562. },
  88563. "connections": {
  88564. "I0": [ "0" ],
  88565. "I1": [ "0" ],
  88566. "I2": [ 4112 ],
  88567. "I3": [ 4111 ],
  88568. "O": [ 4113 ]
  88569. }
  88570. },
  88571. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88572. "hide_name": 0,
  88573. "type": "SB_LUT4",
  88574. "parameters": {
  88575. "LUT_INIT": "0000111111110000"
  88576. },
  88577. "attributes": {
  88578. "module_not_derived": "00000000000000000000000000000001",
  88579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88580. },
  88581. "port_directions": {
  88582. "I0": "input",
  88583. "I1": "input",
  88584. "I2": "input",
  88585. "I3": "input",
  88586. "O": "output"
  88587. },
  88588. "connections": {
  88589. "I0": [ "0" ],
  88590. "I1": [ "0" ],
  88591. "I2": [ 4115 ],
  88592. "I3": [ 3987 ],
  88593. "O": [ 4112 ]
  88594. }
  88595. },
  88596. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88597. "hide_name": 0,
  88598. "type": "SB_CARRY",
  88599. "parameters": {
  88600. },
  88601. "attributes": {
  88602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88603. },
  88604. "port_directions": {
  88605. "CI": "input",
  88606. "CO": "output",
  88607. "I0": "input",
  88608. "I1": "input"
  88609. },
  88610. "connections": {
  88611. "CI": [ 4116 ],
  88612. "CO": [ 4111 ],
  88613. "I0": [ "0" ],
  88614. "I1": [ 4117 ]
  88615. }
  88616. },
  88617. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6": {
  88618. "hide_name": 0,
  88619. "type": "SB_LUT4",
  88620. "parameters": {
  88621. "LUT_INIT": "1100110011110000"
  88622. },
  88623. "attributes": {
  88624. "module_not_derived": "00000000000000000000000000000001",
  88625. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88626. },
  88627. "port_directions": {
  88628. "I0": "input",
  88629. "I1": "input",
  88630. "I2": "input",
  88631. "I3": "input",
  88632. "O": "output"
  88633. },
  88634. "connections": {
  88635. "I0": [ "0" ],
  88636. "I1": [ 2690 ],
  88637. "I2": [ 4118 ],
  88638. "I3": [ 1018 ],
  88639. "O": [ 4119 ]
  88640. }
  88641. },
  88642. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6_I2_SB_LUT4_O": {
  88643. "hide_name": 0,
  88644. "type": "SB_LUT4",
  88645. "parameters": {
  88646. "LUT_INIT": "0110100110010110"
  88647. },
  88648. "attributes": {
  88649. "module_not_derived": "00000000000000000000000000000001",
  88650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88651. },
  88652. "port_directions": {
  88653. "I0": "input",
  88654. "I1": "input",
  88655. "I2": "input",
  88656. "I3": "input",
  88657. "O": "output"
  88658. },
  88659. "connections": {
  88660. "I0": [ "0" ],
  88661. "I1": [ "0" ],
  88662. "I2": [ 4117 ],
  88663. "I3": [ 4116 ],
  88664. "O": [ 4118 ]
  88665. }
  88666. },
  88667. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88668. "hide_name": 0,
  88669. "type": "SB_LUT4",
  88670. "parameters": {
  88671. "LUT_INIT": "0000111111110000"
  88672. },
  88673. "attributes": {
  88674. "module_not_derived": "00000000000000000000000000000001",
  88675. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88676. },
  88677. "port_directions": {
  88678. "I0": "input",
  88679. "I1": "input",
  88680. "I2": "input",
  88681. "I3": "input",
  88682. "O": "output"
  88683. },
  88684. "connections": {
  88685. "I0": [ "0" ],
  88686. "I1": [ "0" ],
  88687. "I2": [ 4120 ],
  88688. "I3": [ 3987 ],
  88689. "O": [ 4117 ]
  88690. }
  88691. },
  88692. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88693. "hide_name": 0,
  88694. "type": "SB_CARRY",
  88695. "parameters": {
  88696. },
  88697. "attributes": {
  88698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88699. },
  88700. "port_directions": {
  88701. "CI": "input",
  88702. "CO": "output",
  88703. "I0": "input",
  88704. "I1": "input"
  88705. },
  88706. "connections": {
  88707. "CI": [ 4121 ],
  88708. "CO": [ 4116 ],
  88709. "I0": [ "0" ],
  88710. "I1": [ 4122 ]
  88711. }
  88712. },
  88713. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7": {
  88714. "hide_name": 0,
  88715. "type": "SB_LUT4",
  88716. "parameters": {
  88717. "LUT_INIT": "1100110011110000"
  88718. },
  88719. "attributes": {
  88720. "module_not_derived": "00000000000000000000000000000001",
  88721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88722. },
  88723. "port_directions": {
  88724. "I0": "input",
  88725. "I1": "input",
  88726. "I2": "input",
  88727. "I3": "input",
  88728. "O": "output"
  88729. },
  88730. "connections": {
  88731. "I0": [ "0" ],
  88732. "I1": [ 2685 ],
  88733. "I2": [ 4123 ],
  88734. "I3": [ 1018 ],
  88735. "O": [ 4124 ]
  88736. }
  88737. },
  88738. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7_I2_SB_LUT4_O": {
  88739. "hide_name": 0,
  88740. "type": "SB_LUT4",
  88741. "parameters": {
  88742. "LUT_INIT": "0110100110010110"
  88743. },
  88744. "attributes": {
  88745. "module_not_derived": "00000000000000000000000000000001",
  88746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88747. },
  88748. "port_directions": {
  88749. "I0": "input",
  88750. "I1": "input",
  88751. "I2": "input",
  88752. "I3": "input",
  88753. "O": "output"
  88754. },
  88755. "connections": {
  88756. "I0": [ "0" ],
  88757. "I1": [ "0" ],
  88758. "I2": [ 4122 ],
  88759. "I3": [ 4121 ],
  88760. "O": [ 4123 ]
  88761. }
  88762. },
  88763. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88764. "hide_name": 0,
  88765. "type": "SB_LUT4",
  88766. "parameters": {
  88767. "LUT_INIT": "0000111111110000"
  88768. },
  88769. "attributes": {
  88770. "module_not_derived": "00000000000000000000000000000001",
  88771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88772. },
  88773. "port_directions": {
  88774. "I0": "input",
  88775. "I1": "input",
  88776. "I2": "input",
  88777. "I3": "input",
  88778. "O": "output"
  88779. },
  88780. "connections": {
  88781. "I0": [ "0" ],
  88782. "I1": [ "0" ],
  88783. "I2": [ 2848 ],
  88784. "I3": [ 3987 ],
  88785. "O": [ 4122 ]
  88786. }
  88787. },
  88788. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88789. "hide_name": 0,
  88790. "type": "SB_CARRY",
  88791. "parameters": {
  88792. },
  88793. "attributes": {
  88794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88795. },
  88796. "port_directions": {
  88797. "CI": "input",
  88798. "CO": "output",
  88799. "I0": "input",
  88800. "I1": "input"
  88801. },
  88802. "connections": {
  88803. "CI": [ 4125 ],
  88804. "CO": [ 4121 ],
  88805. "I0": [ "0" ],
  88806. "I1": [ 4126 ]
  88807. }
  88808. },
  88809. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_8": {
  88810. "hide_name": 0,
  88811. "type": "SB_LUT4",
  88812. "parameters": {
  88813. "LUT_INIT": "1100111111000000"
  88814. },
  88815. "attributes": {
  88816. "module_not_derived": "00000000000000000000000000000001",
  88817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88818. },
  88819. "port_directions": {
  88820. "I0": "input",
  88821. "I1": "input",
  88822. "I2": "input",
  88823. "I3": "input",
  88824. "O": "output"
  88825. },
  88826. "connections": {
  88827. "I0": [ "0" ],
  88828. "I1": [ 2675 ],
  88829. "I2": [ 1018 ],
  88830. "I3": [ 4127 ],
  88831. "O": [ 4128 ]
  88832. }
  88833. },
  88834. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_8_I3_SB_LUT4_O": {
  88835. "hide_name": 0,
  88836. "type": "SB_LUT4",
  88837. "parameters": {
  88838. "LUT_INIT": "0110100110010110"
  88839. },
  88840. "attributes": {
  88841. "module_not_derived": "00000000000000000000000000000001",
  88842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88843. },
  88844. "port_directions": {
  88845. "I0": "input",
  88846. "I1": "input",
  88847. "I2": "input",
  88848. "I3": "input",
  88849. "O": "output"
  88850. },
  88851. "connections": {
  88852. "I0": [ "0" ],
  88853. "I1": [ "0" ],
  88854. "I2": [ 3991 ],
  88855. "I3": [ 3990 ],
  88856. "O": [ 4127 ]
  88857. }
  88858. },
  88859. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9": {
  88860. "hide_name": 0,
  88861. "type": "SB_LUT4",
  88862. "parameters": {
  88863. "LUT_INIT": "1100110011110000"
  88864. },
  88865. "attributes": {
  88866. "module_not_derived": "00000000000000000000000000000001",
  88867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  88868. },
  88869. "port_directions": {
  88870. "I0": "input",
  88871. "I1": "input",
  88872. "I2": "input",
  88873. "I3": "input",
  88874. "O": "output"
  88875. },
  88876. "connections": {
  88877. "I0": [ "0" ],
  88878. "I1": [ 2668 ],
  88879. "I2": [ 4129 ],
  88880. "I3": [ 1018 ],
  88881. "O": [ 4130 ]
  88882. }
  88883. },
  88884. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O": {
  88885. "hide_name": 0,
  88886. "type": "SB_LUT4",
  88887. "parameters": {
  88888. "LUT_INIT": "0110100110010110"
  88889. },
  88890. "attributes": {
  88891. "module_not_derived": "00000000000000000000000000000001",
  88892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  88893. },
  88894. "port_directions": {
  88895. "I0": "input",
  88896. "I1": "input",
  88897. "I2": "input",
  88898. "I3": "input",
  88899. "O": "output"
  88900. },
  88901. "connections": {
  88902. "I0": [ "0" ],
  88903. "I1": [ "0" ],
  88904. "I2": [ 4126 ],
  88905. "I3": [ 4125 ],
  88906. "O": [ 4129 ]
  88907. }
  88908. },
  88909. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  88910. "hide_name": 0,
  88911. "type": "SB_LUT4",
  88912. "parameters": {
  88913. "LUT_INIT": "0000111111110000"
  88914. },
  88915. "attributes": {
  88916. "module_not_derived": "00000000000000000000000000000001",
  88917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88918. },
  88919. "port_directions": {
  88920. "I0": "input",
  88921. "I1": "input",
  88922. "I2": "input",
  88923. "I3": "input",
  88924. "O": "output"
  88925. },
  88926. "connections": {
  88927. "I0": [ "0" ],
  88928. "I1": [ "0" ],
  88929. "I2": [ 2759 ],
  88930. "I3": [ 3987 ],
  88931. "O": [ 4126 ]
  88932. }
  88933. },
  88934. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  88935. "hide_name": 0,
  88936. "type": "SB_CARRY",
  88937. "parameters": {
  88938. },
  88939. "attributes": {
  88940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88941. },
  88942. "port_directions": {
  88943. "CI": "input",
  88944. "CO": "output",
  88945. "I0": "input",
  88946. "I1": "input"
  88947. },
  88948. "connections": {
  88949. "CI": [ 4131 ],
  88950. "CO": [ 4125 ],
  88951. "I0": [ "0" ],
  88952. "I1": [ 4132 ]
  88953. }
  88954. },
  88955. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  88956. "hide_name": 0,
  88957. "type": "SB_CARRY",
  88958. "parameters": {
  88959. },
  88960. "attributes": {
  88961. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  88962. },
  88963. "port_directions": {
  88964. "CI": "input",
  88965. "CO": "output",
  88966. "I0": "input",
  88967. "I1": "input"
  88968. },
  88969. "connections": {
  88970. "CI": [ "0" ],
  88971. "CO": [ 4131 ],
  88972. "I0": [ 3987 ],
  88973. "I1": [ 4133 ]
  88974. }
  88975. },
  88976. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I1_SB_LUT4_O": {
  88977. "hide_name": 0,
  88978. "type": "SB_LUT4",
  88979. "parameters": {
  88980. "LUT_INIT": "0000111111110000"
  88981. },
  88982. "attributes": {
  88983. "module_not_derived": "00000000000000000000000000000001",
  88984. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  88985. },
  88986. "port_directions": {
  88987. "I0": "input",
  88988. "I1": "input",
  88989. "I2": "input",
  88990. "I3": "input",
  88991. "O": "output"
  88992. },
  88993. "connections": {
  88994. "I0": [ "0" ],
  88995. "I1": [ "0" ],
  88996. "I2": [ 2842 ],
  88997. "I3": [ 3987 ],
  88998. "O": [ 4133 ]
  88999. }
  89000. },
  89001. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2": {
  89002. "hide_name": 0,
  89003. "type": "SB_LUT4",
  89004. "parameters": {
  89005. "LUT_INIT": "0110100110010110"
  89006. },
  89007. "attributes": {
  89008. "module_not_derived": "00000000000000000000000000000001",
  89009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89010. },
  89011. "port_directions": {
  89012. "I0": "input",
  89013. "I1": "input",
  89014. "I2": "input",
  89015. "I3": "input",
  89016. "O": "output"
  89017. },
  89018. "connections": {
  89019. "I0": [ "0" ],
  89020. "I1": [ "0" ],
  89021. "I2": [ 4132 ],
  89022. "I3": [ 4131 ],
  89023. "O": [ 3994 ]
  89024. }
  89025. },
  89026. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_O": {
  89027. "hide_name": 0,
  89028. "type": "SB_LUT4",
  89029. "parameters": {
  89030. "LUT_INIT": "0000000000001111"
  89031. },
  89032. "attributes": {
  89033. "module_not_derived": "00000000000000000000000000000001",
  89034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89035. },
  89036. "port_directions": {
  89037. "I0": "input",
  89038. "I1": "input",
  89039. "I2": "input",
  89040. "I3": "input",
  89041. "O": "output"
  89042. },
  89043. "connections": {
  89044. "I0": [ "0" ],
  89045. "I1": [ "0" ],
  89046. "I2": [ 4134 ],
  89047. "I3": [ 4135 ],
  89048. "O": [ 3995 ]
  89049. }
  89050. },
  89051. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O": {
  89052. "hide_name": 0,
  89053. "type": "SB_LUT4",
  89054. "parameters": {
  89055. "LUT_INIT": "0000111111110000"
  89056. },
  89057. "attributes": {
  89058. "module_not_derived": "00000000000000000000000000000001",
  89059. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89060. },
  89061. "port_directions": {
  89062. "I0": "input",
  89063. "I1": "input",
  89064. "I2": "input",
  89065. "I3": "input",
  89066. "O": "output"
  89067. },
  89068. "connections": {
  89069. "I0": [ "0" ],
  89070. "I1": [ "0" ],
  89071. "I2": [ 2770 ],
  89072. "I3": [ 3987 ],
  89073. "O": [ 4132 ]
  89074. }
  89075. },
  89076. "cpu_I.decode_to_execute_IS_MUL_SB_DFFE_Q": {
  89077. "hide_name": 0,
  89078. "type": "SB_DFFE",
  89079. "parameters": {
  89080. },
  89081. "attributes": {
  89082. "module_not_derived": "00000000000000000000000000000001",
  89083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  89084. },
  89085. "port_directions": {
  89086. "C": "input",
  89087. "D": "input",
  89088. "E": "input",
  89089. "Q": "output"
  89090. },
  89091. "connections": {
  89092. "C": [ 42 ],
  89093. "D": [ 2588 ],
  89094. "E": [ 2263 ],
  89095. "Q": [ 4136 ]
  89096. }
  89097. },
  89098. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_DFFE_Q": {
  89099. "hide_name": 0,
  89100. "type": "SB_DFFE",
  89101. "parameters": {
  89102. },
  89103. "attributes": {
  89104. "module_not_derived": "00000000000000000000000000000001",
  89105. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  89106. },
  89107. "port_directions": {
  89108. "C": "input",
  89109. "D": "input",
  89110. "E": "input",
  89111. "Q": "output"
  89112. },
  89113. "connections": {
  89114. "C": [ 42 ],
  89115. "D": [ 2327 ],
  89116. "E": [ 2263 ],
  89117. "Q": [ 3985 ]
  89118. }
  89119. },
  89120. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1": {
  89121. "hide_name": 0,
  89122. "type": "SB_LUT4",
  89123. "parameters": {
  89124. "LUT_INIT": "1101110100100010"
  89125. },
  89126. "attributes": {
  89127. "module_not_derived": "00000000000000000000000000000001",
  89128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89129. },
  89130. "port_directions": {
  89131. "I0": "input",
  89132. "I1": "input",
  89133. "I2": "input",
  89134. "I3": "input",
  89135. "O": "output"
  89136. },
  89137. "connections": {
  89138. "I0": [ 3661 ],
  89139. "I1": [ 3985 ],
  89140. "I2": [ "0" ],
  89141. "I3": [ 4137 ],
  89142. "O": [ 4138 ]
  89143. }
  89144. },
  89145. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_I3_SB_CARRY_CO": {
  89146. "hide_name": 0,
  89147. "type": "SB_CARRY",
  89148. "parameters": {
  89149. },
  89150. "attributes": {
  89151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89152. },
  89153. "port_directions": {
  89154. "CI": "input",
  89155. "CO": "output",
  89156. "I0": "input",
  89157. "I1": "input"
  89158. },
  89159. "connections": {
  89160. "CI": [ 4139 ],
  89161. "CO": [ 4137 ],
  89162. "I0": [ "0" ],
  89163. "I1": [ 4140 ]
  89164. }
  89165. },
  89166. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O": {
  89167. "hide_name": 0,
  89168. "type": "SB_LUT4",
  89169. "parameters": {
  89170. "LUT_INIT": "0110100110010110"
  89171. },
  89172. "attributes": {
  89173. "module_not_derived": "00000000000000000000000000000001",
  89174. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89175. },
  89176. "port_directions": {
  89177. "I0": "input",
  89178. "I1": "input",
  89179. "I2": "input",
  89180. "I3": "input",
  89181. "O": "output"
  89182. },
  89183. "connections": {
  89184. "I0": [ "0" ],
  89185. "I1": [ "0" ],
  89186. "I2": [ 4141 ],
  89187. "I3": [ 4142 ],
  89188. "O": [ 4143 ]
  89189. }
  89190. },
  89191. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_1": {
  89192. "hide_name": 0,
  89193. "type": "SB_LUT4",
  89194. "parameters": {
  89195. "LUT_INIT": "0110100110010110"
  89196. },
  89197. "attributes": {
  89198. "module_not_derived": "00000000000000000000000000000001",
  89199. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89200. },
  89201. "port_directions": {
  89202. "I0": "input",
  89203. "I1": "input",
  89204. "I2": "input",
  89205. "I3": "input",
  89206. "O": "output"
  89207. },
  89208. "connections": {
  89209. "I0": [ "0" ],
  89210. "I1": [ "0" ],
  89211. "I2": [ 4144 ],
  89212. "I3": [ 4145 ],
  89213. "O": [ 4146 ]
  89214. }
  89215. },
  89216. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_10": {
  89217. "hide_name": 0,
  89218. "type": "SB_LUT4",
  89219. "parameters": {
  89220. "LUT_INIT": "0110100110010110"
  89221. },
  89222. "attributes": {
  89223. "module_not_derived": "00000000000000000000000000000001",
  89224. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89225. },
  89226. "port_directions": {
  89227. "I0": "input",
  89228. "I1": "input",
  89229. "I2": "input",
  89230. "I3": "input",
  89231. "O": "output"
  89232. },
  89233. "connections": {
  89234. "I0": [ "0" ],
  89235. "I1": [ "0" ],
  89236. "I2": [ 4147 ],
  89237. "I3": [ 4148 ],
  89238. "O": [ 4149 ]
  89239. }
  89240. },
  89241. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_10_I2_SB_LUT4_O": {
  89242. "hide_name": 0,
  89243. "type": "SB_LUT4",
  89244. "parameters": {
  89245. "LUT_INIT": "0000111111110000"
  89246. },
  89247. "attributes": {
  89248. "module_not_derived": "00000000000000000000000000000001",
  89249. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89250. },
  89251. "port_directions": {
  89252. "I0": "input",
  89253. "I1": "input",
  89254. "I2": "input",
  89255. "I3": "input",
  89256. "O": "output"
  89257. },
  89258. "connections": {
  89259. "I0": [ "0" ],
  89260. "I1": [ "0" ],
  89261. "I2": [ 3672 ],
  89262. "I3": [ 4150 ],
  89263. "O": [ 4147 ]
  89264. }
  89265. },
  89266. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  89267. "hide_name": 0,
  89268. "type": "SB_CARRY",
  89269. "parameters": {
  89270. },
  89271. "attributes": {
  89272. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89273. },
  89274. "port_directions": {
  89275. "CI": "input",
  89276. "CO": "output",
  89277. "I0": "input",
  89278. "I1": "input"
  89279. },
  89280. "connections": {
  89281. "CI": [ 4151 ],
  89282. "CO": [ 4148 ],
  89283. "I0": [ "0" ],
  89284. "I1": [ 4152 ]
  89285. }
  89286. },
  89287. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_11": {
  89288. "hide_name": 0,
  89289. "type": "SB_LUT4",
  89290. "parameters": {
  89291. "LUT_INIT": "0110100110010110"
  89292. },
  89293. "attributes": {
  89294. "module_not_derived": "00000000000000000000000000000001",
  89295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89296. },
  89297. "port_directions": {
  89298. "I0": "input",
  89299. "I1": "input",
  89300. "I2": "input",
  89301. "I3": "input",
  89302. "O": "output"
  89303. },
  89304. "connections": {
  89305. "I0": [ "0" ],
  89306. "I1": [ "0" ],
  89307. "I2": [ 4153 ],
  89308. "I3": [ 4154 ],
  89309. "O": [ 4155 ]
  89310. }
  89311. },
  89312. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_11_I2_SB_LUT4_O": {
  89313. "hide_name": 0,
  89314. "type": "SB_LUT4",
  89315. "parameters": {
  89316. "LUT_INIT": "0000111111110000"
  89317. },
  89318. "attributes": {
  89319. "module_not_derived": "00000000000000000000000000000001",
  89320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89321. },
  89322. "port_directions": {
  89323. "I0": "input",
  89324. "I1": "input",
  89325. "I2": "input",
  89326. "I3": "input",
  89327. "O": "output"
  89328. },
  89329. "connections": {
  89330. "I0": [ "0" ],
  89331. "I1": [ "0" ],
  89332. "I2": [ 2934 ],
  89333. "I3": [ 4150 ],
  89334. "O": [ 4153 ]
  89335. }
  89336. },
  89337. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  89338. "hide_name": 0,
  89339. "type": "SB_CARRY",
  89340. "parameters": {
  89341. },
  89342. "attributes": {
  89343. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89344. },
  89345. "port_directions": {
  89346. "CI": "input",
  89347. "CO": "output",
  89348. "I0": "input",
  89349. "I1": "input"
  89350. },
  89351. "connections": {
  89352. "CI": [ 4148 ],
  89353. "CO": [ 4154 ],
  89354. "I0": [ "0" ],
  89355. "I1": [ 4147 ]
  89356. }
  89357. },
  89358. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_12": {
  89359. "hide_name": 0,
  89360. "type": "SB_LUT4",
  89361. "parameters": {
  89362. "LUT_INIT": "0110100110010110"
  89363. },
  89364. "attributes": {
  89365. "module_not_derived": "00000000000000000000000000000001",
  89366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89367. },
  89368. "port_directions": {
  89369. "I0": "input",
  89370. "I1": "input",
  89371. "I2": "input",
  89372. "I3": "input",
  89373. "O": "output"
  89374. },
  89375. "connections": {
  89376. "I0": [ "0" ],
  89377. "I1": [ "0" ],
  89378. "I2": [ 4156 ],
  89379. "I3": [ 4157 ],
  89380. "O": [ 4158 ]
  89381. }
  89382. },
  89383. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_12_I2_SB_LUT4_O": {
  89384. "hide_name": 0,
  89385. "type": "SB_LUT4",
  89386. "parameters": {
  89387. "LUT_INIT": "0000111111110000"
  89388. },
  89389. "attributes": {
  89390. "module_not_derived": "00000000000000000000000000000001",
  89391. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89392. },
  89393. "port_directions": {
  89394. "I0": "input",
  89395. "I1": "input",
  89396. "I2": "input",
  89397. "I3": "input",
  89398. "O": "output"
  89399. },
  89400. "connections": {
  89401. "I0": [ "0" ],
  89402. "I1": [ "0" ],
  89403. "I2": [ 3668 ],
  89404. "I3": [ 4150 ],
  89405. "O": [ 4156 ]
  89406. }
  89407. },
  89408. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  89409. "hide_name": 0,
  89410. "type": "SB_CARRY",
  89411. "parameters": {
  89412. },
  89413. "attributes": {
  89414. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89415. },
  89416. "port_directions": {
  89417. "CI": "input",
  89418. "CO": "output",
  89419. "I0": "input",
  89420. "I1": "input"
  89421. },
  89422. "connections": {
  89423. "CI": [ 4154 ],
  89424. "CO": [ 4157 ],
  89425. "I0": [ "0" ],
  89426. "I1": [ 4153 ]
  89427. }
  89428. },
  89429. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_13": {
  89430. "hide_name": 0,
  89431. "type": "SB_LUT4",
  89432. "parameters": {
  89433. "LUT_INIT": "0110100110010110"
  89434. },
  89435. "attributes": {
  89436. "module_not_derived": "00000000000000000000000000000001",
  89437. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89438. },
  89439. "port_directions": {
  89440. "I0": "input",
  89441. "I1": "input",
  89442. "I2": "input",
  89443. "I3": "input",
  89444. "O": "output"
  89445. },
  89446. "connections": {
  89447. "I0": [ "0" ],
  89448. "I1": [ "0" ],
  89449. "I2": [ 4159 ],
  89450. "I3": [ 4160 ],
  89451. "O": [ 4161 ]
  89452. }
  89453. },
  89454. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_13_I2_SB_LUT4_O": {
  89455. "hide_name": 0,
  89456. "type": "SB_LUT4",
  89457. "parameters": {
  89458. "LUT_INIT": "0000111111110000"
  89459. },
  89460. "attributes": {
  89461. "module_not_derived": "00000000000000000000000000000001",
  89462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89463. },
  89464. "port_directions": {
  89465. "I0": "input",
  89466. "I1": "input",
  89467. "I2": "input",
  89468. "I3": "input",
  89469. "O": "output"
  89470. },
  89471. "connections": {
  89472. "I0": [ "0" ],
  89473. "I1": [ "0" ],
  89474. "I2": [ 3666 ],
  89475. "I3": [ 4150 ],
  89476. "O": [ 4159 ]
  89477. }
  89478. },
  89479. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  89480. "hide_name": 0,
  89481. "type": "SB_CARRY",
  89482. "parameters": {
  89483. },
  89484. "attributes": {
  89485. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89486. },
  89487. "port_directions": {
  89488. "CI": "input",
  89489. "CO": "output",
  89490. "I0": "input",
  89491. "I1": "input"
  89492. },
  89493. "connections": {
  89494. "CI": [ 4157 ],
  89495. "CO": [ 4160 ],
  89496. "I0": [ "0" ],
  89497. "I1": [ 4156 ]
  89498. }
  89499. },
  89500. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_14": {
  89501. "hide_name": 0,
  89502. "type": "SB_LUT4",
  89503. "parameters": {
  89504. "LUT_INIT": "0110100110010110"
  89505. },
  89506. "attributes": {
  89507. "module_not_derived": "00000000000000000000000000000001",
  89508. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89509. },
  89510. "port_directions": {
  89511. "I0": "input",
  89512. "I1": "input",
  89513. "I2": "input",
  89514. "I3": "input",
  89515. "O": "output"
  89516. },
  89517. "connections": {
  89518. "I0": [ "0" ],
  89519. "I1": [ "0" ],
  89520. "I2": [ 4162 ],
  89521. "I3": [ 4163 ],
  89522. "O": [ 4164 ]
  89523. }
  89524. },
  89525. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_14_I2_SB_LUT4_O": {
  89526. "hide_name": 0,
  89527. "type": "SB_LUT4",
  89528. "parameters": {
  89529. "LUT_INIT": "0000111111110000"
  89530. },
  89531. "attributes": {
  89532. "module_not_derived": "00000000000000000000000000000001",
  89533. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89534. },
  89535. "port_directions": {
  89536. "I0": "input",
  89537. "I1": "input",
  89538. "I2": "input",
  89539. "I3": "input",
  89540. "O": "output"
  89541. },
  89542. "connections": {
  89543. "I0": [ "0" ],
  89544. "I1": [ "0" ],
  89545. "I2": [ 2954 ],
  89546. "I3": [ 4150 ],
  89547. "O": [ 4162 ]
  89548. }
  89549. },
  89550. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  89551. "hide_name": 0,
  89552. "type": "SB_CARRY",
  89553. "parameters": {
  89554. },
  89555. "attributes": {
  89556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89557. },
  89558. "port_directions": {
  89559. "CI": "input",
  89560. "CO": "output",
  89561. "I0": "input",
  89562. "I1": "input"
  89563. },
  89564. "connections": {
  89565. "CI": [ 4160 ],
  89566. "CO": [ 4163 ],
  89567. "I0": [ "0" ],
  89568. "I1": [ 4159 ]
  89569. }
  89570. },
  89571. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_15": {
  89572. "hide_name": 0,
  89573. "type": "SB_LUT4",
  89574. "parameters": {
  89575. "LUT_INIT": "0110100110010110"
  89576. },
  89577. "attributes": {
  89578. "module_not_derived": "00000000000000000000000000000001",
  89579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89580. },
  89581. "port_directions": {
  89582. "I0": "input",
  89583. "I1": "input",
  89584. "I2": "input",
  89585. "I3": "input",
  89586. "O": "output"
  89587. },
  89588. "connections": {
  89589. "I0": [ "0" ],
  89590. "I1": [ "0" ],
  89591. "I2": [ 4165 ],
  89592. "I3": [ 4166 ],
  89593. "O": [ 4167 ]
  89594. }
  89595. },
  89596. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_15_I2_SB_LUT4_O": {
  89597. "hide_name": 0,
  89598. "type": "SB_LUT4",
  89599. "parameters": {
  89600. "LUT_INIT": "0000111111110000"
  89601. },
  89602. "attributes": {
  89603. "module_not_derived": "00000000000000000000000000000001",
  89604. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89605. },
  89606. "port_directions": {
  89607. "I0": "input",
  89608. "I1": "input",
  89609. "I2": "input",
  89610. "I3": "input",
  89611. "O": "output"
  89612. },
  89613. "connections": {
  89614. "I0": [ "0" ],
  89615. "I1": [ "0" ],
  89616. "I2": [ 3684 ],
  89617. "I3": [ 4150 ],
  89618. "O": [ 4165 ]
  89619. }
  89620. },
  89621. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  89622. "hide_name": 0,
  89623. "type": "SB_CARRY",
  89624. "parameters": {
  89625. },
  89626. "attributes": {
  89627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89628. },
  89629. "port_directions": {
  89630. "CI": "input",
  89631. "CO": "output",
  89632. "I0": "input",
  89633. "I1": "input"
  89634. },
  89635. "connections": {
  89636. "CI": [ 4163 ],
  89637. "CO": [ 4166 ],
  89638. "I0": [ "0" ],
  89639. "I1": [ 4162 ]
  89640. }
  89641. },
  89642. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_16": {
  89643. "hide_name": 0,
  89644. "type": "SB_LUT4",
  89645. "parameters": {
  89646. "LUT_INIT": "0110100110010110"
  89647. },
  89648. "attributes": {
  89649. "module_not_derived": "00000000000000000000000000000001",
  89650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89651. },
  89652. "port_directions": {
  89653. "I0": "input",
  89654. "I1": "input",
  89655. "I2": "input",
  89656. "I3": "input",
  89657. "O": "output"
  89658. },
  89659. "connections": {
  89660. "I0": [ "0" ],
  89661. "I1": [ "0" ],
  89662. "I2": [ 4168 ],
  89663. "I3": [ 4169 ],
  89664. "O": [ 4170 ]
  89665. }
  89666. },
  89667. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_16_I2_SB_LUT4_O": {
  89668. "hide_name": 0,
  89669. "type": "SB_LUT4",
  89670. "parameters": {
  89671. "LUT_INIT": "0000111111110000"
  89672. },
  89673. "attributes": {
  89674. "module_not_derived": "00000000000000000000000000000001",
  89675. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89676. },
  89677. "port_directions": {
  89678. "I0": "input",
  89679. "I1": "input",
  89680. "I2": "input",
  89681. "I3": "input",
  89682. "O": "output"
  89683. },
  89684. "connections": {
  89685. "I0": [ "0" ],
  89686. "I1": [ "0" ],
  89687. "I2": [ 3016 ],
  89688. "I3": [ 4150 ],
  89689. "O": [ 4168 ]
  89690. }
  89691. },
  89692. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  89693. "hide_name": 0,
  89694. "type": "SB_CARRY",
  89695. "parameters": {
  89696. },
  89697. "attributes": {
  89698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89699. },
  89700. "port_directions": {
  89701. "CI": "input",
  89702. "CO": "output",
  89703. "I0": "input",
  89704. "I1": "input"
  89705. },
  89706. "connections": {
  89707. "CI": [ 4166 ],
  89708. "CO": [ 4169 ],
  89709. "I0": [ "0" ],
  89710. "I1": [ 4165 ]
  89711. }
  89712. },
  89713. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_17": {
  89714. "hide_name": 0,
  89715. "type": "SB_LUT4",
  89716. "parameters": {
  89717. "LUT_INIT": "0110100110010110"
  89718. },
  89719. "attributes": {
  89720. "module_not_derived": "00000000000000000000000000000001",
  89721. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89722. },
  89723. "port_directions": {
  89724. "I0": "input",
  89725. "I1": "input",
  89726. "I2": "input",
  89727. "I3": "input",
  89728. "O": "output"
  89729. },
  89730. "connections": {
  89731. "I0": [ "0" ],
  89732. "I1": [ "0" ],
  89733. "I2": [ 4171 ],
  89734. "I3": [ 4172 ],
  89735. "O": [ 4173 ]
  89736. }
  89737. },
  89738. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_17_I2_SB_LUT4_O": {
  89739. "hide_name": 0,
  89740. "type": "SB_LUT4",
  89741. "parameters": {
  89742. "LUT_INIT": "0000111111110000"
  89743. },
  89744. "attributes": {
  89745. "module_not_derived": "00000000000000000000000000000001",
  89746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89747. },
  89748. "port_directions": {
  89749. "I0": "input",
  89750. "I1": "input",
  89751. "I2": "input",
  89752. "I3": "input",
  89753. "O": "output"
  89754. },
  89755. "connections": {
  89756. "I0": [ "0" ],
  89757. "I1": [ "0" ],
  89758. "I2": [ 3643 ],
  89759. "I3": [ 4150 ],
  89760. "O": [ 4171 ]
  89761. }
  89762. },
  89763. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_17_I3_SB_CARRY_CO": {
  89764. "hide_name": 0,
  89765. "type": "SB_CARRY",
  89766. "parameters": {
  89767. },
  89768. "attributes": {
  89769. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89770. },
  89771. "port_directions": {
  89772. "CI": "input",
  89773. "CO": "output",
  89774. "I0": "input",
  89775. "I1": "input"
  89776. },
  89777. "connections": {
  89778. "CI": [ 4169 ],
  89779. "CO": [ 4172 ],
  89780. "I0": [ "0" ],
  89781. "I1": [ 4168 ]
  89782. }
  89783. },
  89784. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_18": {
  89785. "hide_name": 0,
  89786. "type": "SB_LUT4",
  89787. "parameters": {
  89788. "LUT_INIT": "0110100110010110"
  89789. },
  89790. "attributes": {
  89791. "module_not_derived": "00000000000000000000000000000001",
  89792. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89793. },
  89794. "port_directions": {
  89795. "I0": "input",
  89796. "I1": "input",
  89797. "I2": "input",
  89798. "I3": "input",
  89799. "O": "output"
  89800. },
  89801. "connections": {
  89802. "I0": [ "0" ],
  89803. "I1": [ "0" ],
  89804. "I2": [ 4174 ],
  89805. "I3": [ 4175 ],
  89806. "O": [ 4176 ]
  89807. }
  89808. },
  89809. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_18_I2_SB_LUT4_O": {
  89810. "hide_name": 0,
  89811. "type": "SB_LUT4",
  89812. "parameters": {
  89813. "LUT_INIT": "0000111111110000"
  89814. },
  89815. "attributes": {
  89816. "module_not_derived": "00000000000000000000000000000001",
  89817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89818. },
  89819. "port_directions": {
  89820. "I0": "input",
  89821. "I1": "input",
  89822. "I2": "input",
  89823. "I3": "input",
  89824. "O": "output"
  89825. },
  89826. "connections": {
  89827. "I0": [ "0" ],
  89828. "I1": [ "0" ],
  89829. "I2": [ 3647 ],
  89830. "I3": [ 4150 ],
  89831. "O": [ 4174 ]
  89832. }
  89833. },
  89834. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_18_I3_SB_CARRY_CO": {
  89835. "hide_name": 0,
  89836. "type": "SB_CARRY",
  89837. "parameters": {
  89838. },
  89839. "attributes": {
  89840. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89841. },
  89842. "port_directions": {
  89843. "CI": "input",
  89844. "CO": "output",
  89845. "I0": "input",
  89846. "I1": "input"
  89847. },
  89848. "connections": {
  89849. "CI": [ 4172 ],
  89850. "CO": [ 4175 ],
  89851. "I0": [ "0" ],
  89852. "I1": [ 4171 ]
  89853. }
  89854. },
  89855. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_19": {
  89856. "hide_name": 0,
  89857. "type": "SB_LUT4",
  89858. "parameters": {
  89859. "LUT_INIT": "0110100110010110"
  89860. },
  89861. "attributes": {
  89862. "module_not_derived": "00000000000000000000000000000001",
  89863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89864. },
  89865. "port_directions": {
  89866. "I0": "input",
  89867. "I1": "input",
  89868. "I2": "input",
  89869. "I3": "input",
  89870. "O": "output"
  89871. },
  89872. "connections": {
  89873. "I0": [ "0" ],
  89874. "I1": [ "0" ],
  89875. "I2": [ 4177 ],
  89876. "I3": [ 4178 ],
  89877. "O": [ 4179 ]
  89878. }
  89879. },
  89880. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_19_I2_SB_LUT4_O": {
  89881. "hide_name": 0,
  89882. "type": "SB_LUT4",
  89883. "parameters": {
  89884. "LUT_INIT": "0000111111110000"
  89885. },
  89886. "attributes": {
  89887. "module_not_derived": "00000000000000000000000000000001",
  89888. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89889. },
  89890. "port_directions": {
  89891. "I0": "input",
  89892. "I1": "input",
  89893. "I2": "input",
  89894. "I3": "input",
  89895. "O": "output"
  89896. },
  89897. "connections": {
  89898. "I0": [ "0" ],
  89899. "I1": [ "0" ],
  89900. "I2": [ 2996 ],
  89901. "I3": [ 4150 ],
  89902. "O": [ 4177 ]
  89903. }
  89904. },
  89905. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_19_I3_SB_CARRY_CO": {
  89906. "hide_name": 0,
  89907. "type": "SB_CARRY",
  89908. "parameters": {
  89909. },
  89910. "attributes": {
  89911. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89912. },
  89913. "port_directions": {
  89914. "CI": "input",
  89915. "CO": "output",
  89916. "I0": "input",
  89917. "I1": "input"
  89918. },
  89919. "connections": {
  89920. "CI": [ 4175 ],
  89921. "CO": [ 4178 ],
  89922. "I0": [ "0" ],
  89923. "I1": [ 4174 ]
  89924. }
  89925. },
  89926. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_1_I2_SB_LUT4_O": {
  89927. "hide_name": 0,
  89928. "type": "SB_LUT4",
  89929. "parameters": {
  89930. "LUT_INIT": "0000111111110000"
  89931. },
  89932. "attributes": {
  89933. "module_not_derived": "00000000000000000000000000000001",
  89934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  89935. },
  89936. "port_directions": {
  89937. "I0": "input",
  89938. "I1": "input",
  89939. "I2": "input",
  89940. "I3": "input",
  89941. "O": "output"
  89942. },
  89943. "connections": {
  89944. "I0": [ "0" ],
  89945. "I1": [ "0" ],
  89946. "I2": [ 3076 ],
  89947. "I3": [ 4150 ],
  89948. "O": [ 4144 ]
  89949. }
  89950. },
  89951. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  89952. "hide_name": 0,
  89953. "type": "SB_CARRY",
  89954. "parameters": {
  89955. },
  89956. "attributes": {
  89957. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  89958. },
  89959. "port_directions": {
  89960. "CI": "input",
  89961. "CO": "output",
  89962. "I0": "input",
  89963. "I1": "input"
  89964. },
  89965. "connections": {
  89966. "CI": [ 4142 ],
  89967. "CO": [ 4145 ],
  89968. "I0": [ "0" ],
  89969. "I1": [ 4141 ]
  89970. }
  89971. },
  89972. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_2": {
  89973. "hide_name": 0,
  89974. "type": "SB_LUT4",
  89975. "parameters": {
  89976. "LUT_INIT": "0110100110010110"
  89977. },
  89978. "attributes": {
  89979. "module_not_derived": "00000000000000000000000000000001",
  89980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  89981. },
  89982. "port_directions": {
  89983. "I0": "input",
  89984. "I1": "input",
  89985. "I2": "input",
  89986. "I3": "input",
  89987. "O": "output"
  89988. },
  89989. "connections": {
  89990. "I0": [ "0" ],
  89991. "I1": [ "0" ],
  89992. "I2": [ 4180 ],
  89993. "I3": [ 4181 ],
  89994. "O": [ 4182 ]
  89995. }
  89996. },
  89997. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20": {
  89998. "hide_name": 0,
  89999. "type": "SB_LUT4",
  90000. "parameters": {
  90001. "LUT_INIT": "0110100110010110"
  90002. },
  90003. "attributes": {
  90004. "module_not_derived": "00000000000000000000000000000001",
  90005. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90006. },
  90007. "port_directions": {
  90008. "I0": "input",
  90009. "I1": "input",
  90010. "I2": "input",
  90011. "I3": "input",
  90012. "O": "output"
  90013. },
  90014. "connections": {
  90015. "I0": [ "0" ],
  90016. "I1": [ "0" ],
  90017. "I2": [ 4183 ],
  90018. "I3": [ 4184 ],
  90019. "O": [ 4185 ]
  90020. }
  90021. },
  90022. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20_I2_SB_LUT4_O": {
  90023. "hide_name": 0,
  90024. "type": "SB_LUT4",
  90025. "parameters": {
  90026. "LUT_INIT": "0000111111110000"
  90027. },
  90028. "attributes": {
  90029. "module_not_derived": "00000000000000000000000000000001",
  90030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90031. },
  90032. "port_directions": {
  90033. "I0": "input",
  90034. "I1": "input",
  90035. "I2": "input",
  90036. "I3": "input",
  90037. "O": "output"
  90038. },
  90039. "connections": {
  90040. "I0": [ "0" ],
  90041. "I1": [ "0" ],
  90042. "I2": [ 2535 ],
  90043. "I3": [ 4150 ],
  90044. "O": [ 4183 ]
  90045. }
  90046. },
  90047. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20_I3_SB_CARRY_CO": {
  90048. "hide_name": 0,
  90049. "type": "SB_CARRY",
  90050. "parameters": {
  90051. },
  90052. "attributes": {
  90053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90054. },
  90055. "port_directions": {
  90056. "CI": "input",
  90057. "CO": "output",
  90058. "I0": "input",
  90059. "I1": "input"
  90060. },
  90061. "connections": {
  90062. "CI": [ "0" ],
  90063. "CO": [ 4184 ],
  90064. "I0": [ 4150 ],
  90065. "I1": [ 4186 ]
  90066. }
  90067. },
  90068. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20_I3_SB_CARRY_CO_I1_SB_LUT4_O": {
  90069. "hide_name": 0,
  90070. "type": "SB_LUT4",
  90071. "parameters": {
  90072. "LUT_INIT": "0000111111110000"
  90073. },
  90074. "attributes": {
  90075. "module_not_derived": "00000000000000000000000000000001",
  90076. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90077. },
  90078. "port_directions": {
  90079. "I0": "input",
  90080. "I1": "input",
  90081. "I2": "input",
  90082. "I3": "input",
  90083. "O": "output"
  90084. },
  90085. "connections": {
  90086. "I0": [ "0" ],
  90087. "I1": [ "0" ],
  90088. "I2": [ 3639 ],
  90089. "I3": [ 4150 ],
  90090. "O": [ 4186 ]
  90091. }
  90092. },
  90093. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_21": {
  90094. "hide_name": 0,
  90095. "type": "SB_LUT4",
  90096. "parameters": {
  90097. "LUT_INIT": "0110100110010110"
  90098. },
  90099. "attributes": {
  90100. "module_not_derived": "00000000000000000000000000000001",
  90101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90102. },
  90103. "port_directions": {
  90104. "I0": "input",
  90105. "I1": "input",
  90106. "I2": "input",
  90107. "I3": "input",
  90108. "O": "output"
  90109. },
  90110. "connections": {
  90111. "I0": [ "0" ],
  90112. "I1": [ "0" ],
  90113. "I2": [ 4187 ],
  90114. "I3": [ 4188 ],
  90115. "O": [ 4189 ]
  90116. }
  90117. },
  90118. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_21_I2_SB_LUT4_O": {
  90119. "hide_name": 0,
  90120. "type": "SB_LUT4",
  90121. "parameters": {
  90122. "LUT_INIT": "0000111111110000"
  90123. },
  90124. "attributes": {
  90125. "module_not_derived": "00000000000000000000000000000001",
  90126. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90127. },
  90128. "port_directions": {
  90129. "I0": "input",
  90130. "I1": "input",
  90131. "I2": "input",
  90132. "I3": "input",
  90133. "O": "output"
  90134. },
  90135. "connections": {
  90136. "I0": [ "0" ],
  90137. "I1": [ "0" ],
  90138. "I2": [ 3654 ],
  90139. "I3": [ 4150 ],
  90140. "O": [ 4187 ]
  90141. }
  90142. },
  90143. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_21_I3_SB_CARRY_CO": {
  90144. "hide_name": 0,
  90145. "type": "SB_CARRY",
  90146. "parameters": {
  90147. },
  90148. "attributes": {
  90149. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90150. },
  90151. "port_directions": {
  90152. "CI": "input",
  90153. "CO": "output",
  90154. "I0": "input",
  90155. "I1": "input"
  90156. },
  90157. "connections": {
  90158. "CI": [ 4178 ],
  90159. "CO": [ 4188 ],
  90160. "I0": [ "0" ],
  90161. "I1": [ 4177 ]
  90162. }
  90163. },
  90164. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_22": {
  90165. "hide_name": 0,
  90166. "type": "SB_LUT4",
  90167. "parameters": {
  90168. "LUT_INIT": "0110100110010110"
  90169. },
  90170. "attributes": {
  90171. "module_not_derived": "00000000000000000000000000000001",
  90172. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90173. },
  90174. "port_directions": {
  90175. "I0": "input",
  90176. "I1": "input",
  90177. "I2": "input",
  90178. "I3": "input",
  90179. "O": "output"
  90180. },
  90181. "connections": {
  90182. "I0": [ "0" ],
  90183. "I1": [ "0" ],
  90184. "I2": [ 4140 ],
  90185. "I3": [ 4139 ],
  90186. "O": [ 4190 ]
  90187. }
  90188. },
  90189. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_22_I2_SB_LUT4_O": {
  90190. "hide_name": 0,
  90191. "type": "SB_LUT4",
  90192. "parameters": {
  90193. "LUT_INIT": "0000111111110000"
  90194. },
  90195. "attributes": {
  90196. "module_not_derived": "00000000000000000000000000000001",
  90197. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90198. },
  90199. "port_directions": {
  90200. "I0": "input",
  90201. "I1": "input",
  90202. "I2": "input",
  90203. "I3": "input",
  90204. "O": "output"
  90205. },
  90206. "connections": {
  90207. "I0": [ "0" ],
  90208. "I1": [ "0" ],
  90209. "I2": [ 3658 ],
  90210. "I3": [ 4150 ],
  90211. "O": [ 4140 ]
  90212. }
  90213. },
  90214. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_22_I3_SB_CARRY_CO": {
  90215. "hide_name": 0,
  90216. "type": "SB_CARRY",
  90217. "parameters": {
  90218. },
  90219. "attributes": {
  90220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90221. },
  90222. "port_directions": {
  90223. "CI": "input",
  90224. "CO": "output",
  90225. "I0": "input",
  90226. "I1": "input"
  90227. },
  90228. "connections": {
  90229. "CI": [ 4188 ],
  90230. "CO": [ 4139 ],
  90231. "I0": [ "0" ],
  90232. "I1": [ 4187 ]
  90233. }
  90234. },
  90235. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_23": {
  90236. "hide_name": 0,
  90237. "type": "SB_LUT4",
  90238. "parameters": {
  90239. "LUT_INIT": "0110100110010110"
  90240. },
  90241. "attributes": {
  90242. "module_not_derived": "00000000000000000000000000000001",
  90243. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90244. },
  90245. "port_directions": {
  90246. "I0": "input",
  90247. "I1": "input",
  90248. "I2": "input",
  90249. "I3": "input",
  90250. "O": "output"
  90251. },
  90252. "connections": {
  90253. "I0": [ "0" ],
  90254. "I1": [ "0" ],
  90255. "I2": [ 4191 ],
  90256. "I3": [ 4192 ],
  90257. "O": [ 4193 ]
  90258. }
  90259. },
  90260. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_23_I2_SB_LUT4_O": {
  90261. "hide_name": 0,
  90262. "type": "SB_LUT4",
  90263. "parameters": {
  90264. "LUT_INIT": "0000111111110000"
  90265. },
  90266. "attributes": {
  90267. "module_not_derived": "00000000000000000000000000000001",
  90268. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90269. },
  90270. "port_directions": {
  90271. "I0": "input",
  90272. "I1": "input",
  90273. "I2": "input",
  90274. "I3": "input",
  90275. "O": "output"
  90276. },
  90277. "connections": {
  90278. "I0": [ "0" ],
  90279. "I1": [ "0" ],
  90280. "I2": [ 3646 ],
  90281. "I3": [ 4150 ],
  90282. "O": [ 4191 ]
  90283. }
  90284. },
  90285. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_23_I3_SB_CARRY_CO": {
  90286. "hide_name": 0,
  90287. "type": "SB_CARRY",
  90288. "parameters": {
  90289. },
  90290. "attributes": {
  90291. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90292. },
  90293. "port_directions": {
  90294. "CI": "input",
  90295. "CO": "output",
  90296. "I0": "input",
  90297. "I1": "input"
  90298. },
  90299. "connections": {
  90300. "CI": [ 4184 ],
  90301. "CO": [ 4192 ],
  90302. "I0": [ "0" ],
  90303. "I1": [ 4183 ]
  90304. }
  90305. },
  90306. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_24": {
  90307. "hide_name": 0,
  90308. "type": "SB_LUT4",
  90309. "parameters": {
  90310. "LUT_INIT": "0110100110010110"
  90311. },
  90312. "attributes": {
  90313. "module_not_derived": "00000000000000000000000000000001",
  90314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90315. },
  90316. "port_directions": {
  90317. "I0": "input",
  90318. "I1": "input",
  90319. "I2": "input",
  90320. "I3": "input",
  90321. "O": "output"
  90322. },
  90323. "connections": {
  90324. "I0": [ "0" ],
  90325. "I1": [ "0" ],
  90326. "I2": [ 4194 ],
  90327. "I3": [ 4195 ],
  90328. "O": [ 4196 ]
  90329. }
  90330. },
  90331. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_24_I2_SB_LUT4_O": {
  90332. "hide_name": 0,
  90333. "type": "SB_LUT4",
  90334. "parameters": {
  90335. "LUT_INIT": "0000111111110000"
  90336. },
  90337. "attributes": {
  90338. "module_not_derived": "00000000000000000000000000000001",
  90339. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90340. },
  90341. "port_directions": {
  90342. "I0": "input",
  90343. "I1": "input",
  90344. "I2": "input",
  90345. "I3": "input",
  90346. "O": "output"
  90347. },
  90348. "connections": {
  90349. "I0": [ "0" ],
  90350. "I1": [ "0" ],
  90351. "I2": [ 3650 ],
  90352. "I3": [ 4150 ],
  90353. "O": [ 4194 ]
  90354. }
  90355. },
  90356. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_24_I3_SB_CARRY_CO": {
  90357. "hide_name": 0,
  90358. "type": "SB_CARRY",
  90359. "parameters": {
  90360. },
  90361. "attributes": {
  90362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90363. },
  90364. "port_directions": {
  90365. "CI": "input",
  90366. "CO": "output",
  90367. "I0": "input",
  90368. "I1": "input"
  90369. },
  90370. "connections": {
  90371. "CI": [ 4192 ],
  90372. "CO": [ 4195 ],
  90373. "I0": [ "0" ],
  90374. "I1": [ 4191 ]
  90375. }
  90376. },
  90377. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_25": {
  90378. "hide_name": 0,
  90379. "type": "SB_LUT4",
  90380. "parameters": {
  90381. "LUT_INIT": "0110100110010110"
  90382. },
  90383. "attributes": {
  90384. "module_not_derived": "00000000000000000000000000000001",
  90385. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90386. },
  90387. "port_directions": {
  90388. "I0": "input",
  90389. "I1": "input",
  90390. "I2": "input",
  90391. "I3": "input",
  90392. "O": "output"
  90393. },
  90394. "connections": {
  90395. "I0": [ "0" ],
  90396. "I1": [ "0" ],
  90397. "I2": [ 4197 ],
  90398. "I3": [ 4198 ],
  90399. "O": [ 4199 ]
  90400. }
  90401. },
  90402. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_25_I2_SB_LUT4_O": {
  90403. "hide_name": 0,
  90404. "type": "SB_LUT4",
  90405. "parameters": {
  90406. "LUT_INIT": "0000111111110000"
  90407. },
  90408. "attributes": {
  90409. "module_not_derived": "00000000000000000000000000000001",
  90410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90411. },
  90412. "port_directions": {
  90413. "I0": "input",
  90414. "I1": "input",
  90415. "I2": "input",
  90416. "I3": "input",
  90417. "O": "output"
  90418. },
  90419. "connections": {
  90420. "I0": [ "0" ],
  90421. "I1": [ "0" ],
  90422. "I2": [ 3653 ],
  90423. "I3": [ 4150 ],
  90424. "O": [ 4197 ]
  90425. }
  90426. },
  90427. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_25_I3_SB_CARRY_CO": {
  90428. "hide_name": 0,
  90429. "type": "SB_CARRY",
  90430. "parameters": {
  90431. },
  90432. "attributes": {
  90433. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90434. },
  90435. "port_directions": {
  90436. "CI": "input",
  90437. "CO": "output",
  90438. "I0": "input",
  90439. "I1": "input"
  90440. },
  90441. "connections": {
  90442. "CI": [ 4195 ],
  90443. "CO": [ 4198 ],
  90444. "I0": [ "0" ],
  90445. "I1": [ 4194 ]
  90446. }
  90447. },
  90448. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_26": {
  90449. "hide_name": 0,
  90450. "type": "SB_LUT4",
  90451. "parameters": {
  90452. "LUT_INIT": "0110100110010110"
  90453. },
  90454. "attributes": {
  90455. "module_not_derived": "00000000000000000000000000000001",
  90456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90457. },
  90458. "port_directions": {
  90459. "I0": "input",
  90460. "I1": "input",
  90461. "I2": "input",
  90462. "I3": "input",
  90463. "O": "output"
  90464. },
  90465. "connections": {
  90466. "I0": [ "0" ],
  90467. "I1": [ "0" ],
  90468. "I2": [ 4200 ],
  90469. "I3": [ 4201 ],
  90470. "O": [ 4202 ]
  90471. }
  90472. },
  90473. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_26_I2_SB_LUT4_O": {
  90474. "hide_name": 0,
  90475. "type": "SB_LUT4",
  90476. "parameters": {
  90477. "LUT_INIT": "0000111111110000"
  90478. },
  90479. "attributes": {
  90480. "module_not_derived": "00000000000000000000000000000001",
  90481. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90482. },
  90483. "port_directions": {
  90484. "I0": "input",
  90485. "I1": "input",
  90486. "I2": "input",
  90487. "I3": "input",
  90488. "O": "output"
  90489. },
  90490. "connections": {
  90491. "I0": [ "0" ],
  90492. "I1": [ "0" ],
  90493. "I2": [ 3022 ],
  90494. "I3": [ 4150 ],
  90495. "O": [ 4200 ]
  90496. }
  90497. },
  90498. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_26_I3_SB_CARRY_CO": {
  90499. "hide_name": 0,
  90500. "type": "SB_CARRY",
  90501. "parameters": {
  90502. },
  90503. "attributes": {
  90504. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90505. },
  90506. "port_directions": {
  90507. "CI": "input",
  90508. "CO": "output",
  90509. "I0": "input",
  90510. "I1": "input"
  90511. },
  90512. "connections": {
  90513. "CI": [ 4198 ],
  90514. "CO": [ 4201 ],
  90515. "I0": [ "0" ],
  90516. "I1": [ 4197 ]
  90517. }
  90518. },
  90519. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_27": {
  90520. "hide_name": 0,
  90521. "type": "SB_LUT4",
  90522. "parameters": {
  90523. "LUT_INIT": "0110100110010110"
  90524. },
  90525. "attributes": {
  90526. "module_not_derived": "00000000000000000000000000000001",
  90527. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90528. },
  90529. "port_directions": {
  90530. "I0": "input",
  90531. "I1": "input",
  90532. "I2": "input",
  90533. "I3": "input",
  90534. "O": "output"
  90535. },
  90536. "connections": {
  90537. "I0": [ "0" ],
  90538. "I1": [ "0" ],
  90539. "I2": [ 4203 ],
  90540. "I3": [ 4204 ],
  90541. "O": [ 4205 ]
  90542. }
  90543. },
  90544. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_27_I2_SB_LUT4_O": {
  90545. "hide_name": 0,
  90546. "type": "SB_LUT4",
  90547. "parameters": {
  90548. "LUT_INIT": "0000111111110000"
  90549. },
  90550. "attributes": {
  90551. "module_not_derived": "00000000000000000000000000000001",
  90552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90553. },
  90554. "port_directions": {
  90555. "I0": "input",
  90556. "I1": "input",
  90557. "I2": "input",
  90558. "I3": "input",
  90559. "O": "output"
  90560. },
  90561. "connections": {
  90562. "I0": [ "0" ],
  90563. "I1": [ "0" ],
  90564. "I2": [ 3036 ],
  90565. "I3": [ 4150 ],
  90566. "O": [ 4203 ]
  90567. }
  90568. },
  90569. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_27_I3_SB_CARRY_CO": {
  90570. "hide_name": 0,
  90571. "type": "SB_CARRY",
  90572. "parameters": {
  90573. },
  90574. "attributes": {
  90575. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90576. },
  90577. "port_directions": {
  90578. "CI": "input",
  90579. "CO": "output",
  90580. "I0": "input",
  90581. "I1": "input"
  90582. },
  90583. "connections": {
  90584. "CI": [ 4201 ],
  90585. "CO": [ 4204 ],
  90586. "I0": [ "0" ],
  90587. "I1": [ 4200 ]
  90588. }
  90589. },
  90590. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_28": {
  90591. "hide_name": 0,
  90592. "type": "SB_LUT4",
  90593. "parameters": {
  90594. "LUT_INIT": "0110100110010110"
  90595. },
  90596. "attributes": {
  90597. "module_not_derived": "00000000000000000000000000000001",
  90598. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90599. },
  90600. "port_directions": {
  90601. "I0": "input",
  90602. "I1": "input",
  90603. "I2": "input",
  90604. "I3": "input",
  90605. "O": "output"
  90606. },
  90607. "connections": {
  90608. "I0": [ "0" ],
  90609. "I1": [ "0" ],
  90610. "I2": [ 4206 ],
  90611. "I3": [ 4207 ],
  90612. "O": [ 4208 ]
  90613. }
  90614. },
  90615. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_28_I2_SB_LUT4_O": {
  90616. "hide_name": 0,
  90617. "type": "SB_LUT4",
  90618. "parameters": {
  90619. "LUT_INIT": "0000111111110000"
  90620. },
  90621. "attributes": {
  90622. "module_not_derived": "00000000000000000000000000000001",
  90623. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90624. },
  90625. "port_directions": {
  90626. "I0": "input",
  90627. "I1": "input",
  90628. "I2": "input",
  90629. "I3": "input",
  90630. "O": "output"
  90631. },
  90632. "connections": {
  90633. "I0": [ "0" ],
  90634. "I1": [ "0" ],
  90635. "I2": [ 3047 ],
  90636. "I3": [ 4150 ],
  90637. "O": [ 4206 ]
  90638. }
  90639. },
  90640. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_28_I3_SB_CARRY_CO": {
  90641. "hide_name": 0,
  90642. "type": "SB_CARRY",
  90643. "parameters": {
  90644. },
  90645. "attributes": {
  90646. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90647. },
  90648. "port_directions": {
  90649. "CI": "input",
  90650. "CO": "output",
  90651. "I0": "input",
  90652. "I1": "input"
  90653. },
  90654. "connections": {
  90655. "CI": [ 4204 ],
  90656. "CO": [ 4207 ],
  90657. "I0": [ "0" ],
  90658. "I1": [ 4203 ]
  90659. }
  90660. },
  90661. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_29": {
  90662. "hide_name": 0,
  90663. "type": "SB_LUT4",
  90664. "parameters": {
  90665. "LUT_INIT": "0110100110010110"
  90666. },
  90667. "attributes": {
  90668. "module_not_derived": "00000000000000000000000000000001",
  90669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90670. },
  90671. "port_directions": {
  90672. "I0": "input",
  90673. "I1": "input",
  90674. "I2": "input",
  90675. "I3": "input",
  90676. "O": "output"
  90677. },
  90678. "connections": {
  90679. "I0": [ "0" ],
  90680. "I1": [ "0" ],
  90681. "I2": [ 4209 ],
  90682. "I3": [ 4210 ],
  90683. "O": [ 4211 ]
  90684. }
  90685. },
  90686. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_29_I2_SB_LUT4_O": {
  90687. "hide_name": 0,
  90688. "type": "SB_LUT4",
  90689. "parameters": {
  90690. "LUT_INIT": "0000111111110000"
  90691. },
  90692. "attributes": {
  90693. "module_not_derived": "00000000000000000000000000000001",
  90694. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90695. },
  90696. "port_directions": {
  90697. "I0": "input",
  90698. "I1": "input",
  90699. "I2": "input",
  90700. "I3": "input",
  90701. "O": "output"
  90702. },
  90703. "connections": {
  90704. "I0": [ "0" ],
  90705. "I1": [ "0" ],
  90706. "I2": [ 3061 ],
  90707. "I3": [ 4150 ],
  90708. "O": [ 4209 ]
  90709. }
  90710. },
  90711. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_29_I3_SB_CARRY_CO": {
  90712. "hide_name": 0,
  90713. "type": "SB_CARRY",
  90714. "parameters": {
  90715. },
  90716. "attributes": {
  90717. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90718. },
  90719. "port_directions": {
  90720. "CI": "input",
  90721. "CO": "output",
  90722. "I0": "input",
  90723. "I1": "input"
  90724. },
  90725. "connections": {
  90726. "CI": [ 4207 ],
  90727. "CO": [ 4210 ],
  90728. "I0": [ "0" ],
  90729. "I1": [ 4206 ]
  90730. }
  90731. },
  90732. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_2_I2_SB_LUT4_O": {
  90733. "hide_name": 0,
  90734. "type": "SB_LUT4",
  90735. "parameters": {
  90736. "LUT_INIT": "0000111111110000"
  90737. },
  90738. "attributes": {
  90739. "module_not_derived": "00000000000000000000000000000001",
  90740. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90741. },
  90742. "port_directions": {
  90743. "I0": "input",
  90744. "I1": "input",
  90745. "I2": "input",
  90746. "I3": "input",
  90747. "O": "output"
  90748. },
  90749. "connections": {
  90750. "I0": [ "0" ],
  90751. "I1": [ "0" ],
  90752. "I2": [ 2870 ],
  90753. "I3": [ 4150 ],
  90754. "O": [ 4180 ]
  90755. }
  90756. },
  90757. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  90758. "hide_name": 0,
  90759. "type": "SB_CARRY",
  90760. "parameters": {
  90761. },
  90762. "attributes": {
  90763. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90764. },
  90765. "port_directions": {
  90766. "CI": "input",
  90767. "CO": "output",
  90768. "I0": "input",
  90769. "I1": "input"
  90770. },
  90771. "connections": {
  90772. "CI": [ 4145 ],
  90773. "CO": [ 4181 ],
  90774. "I0": [ "0" ],
  90775. "I1": [ 4144 ]
  90776. }
  90777. },
  90778. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_3": {
  90779. "hide_name": 0,
  90780. "type": "SB_LUT4",
  90781. "parameters": {
  90782. "LUT_INIT": "0110100110010110"
  90783. },
  90784. "attributes": {
  90785. "module_not_derived": "00000000000000000000000000000001",
  90786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90787. },
  90788. "port_directions": {
  90789. "I0": "input",
  90790. "I1": "input",
  90791. "I2": "input",
  90792. "I3": "input",
  90793. "O": "output"
  90794. },
  90795. "connections": {
  90796. "I0": [ "0" ],
  90797. "I1": [ "0" ],
  90798. "I2": [ 4212 ],
  90799. "I3": [ 4213 ],
  90800. "O": [ 4214 ]
  90801. }
  90802. },
  90803. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_3_I2_SB_LUT4_O": {
  90804. "hide_name": 0,
  90805. "type": "SB_LUT4",
  90806. "parameters": {
  90807. "LUT_INIT": "0000111111110000"
  90808. },
  90809. "attributes": {
  90810. "module_not_derived": "00000000000000000000000000000001",
  90811. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90812. },
  90813. "port_directions": {
  90814. "I0": "input",
  90815. "I1": "input",
  90816. "I2": "input",
  90817. "I3": "input",
  90818. "O": "output"
  90819. },
  90820. "connections": {
  90821. "I0": [ "0" ],
  90822. "I1": [ "0" ],
  90823. "I2": [ 2882 ],
  90824. "I3": [ 4150 ],
  90825. "O": [ 4212 ]
  90826. }
  90827. },
  90828. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  90829. "hide_name": 0,
  90830. "type": "SB_CARRY",
  90831. "parameters": {
  90832. },
  90833. "attributes": {
  90834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90835. },
  90836. "port_directions": {
  90837. "CI": "input",
  90838. "CO": "output",
  90839. "I0": "input",
  90840. "I1": "input"
  90841. },
  90842. "connections": {
  90843. "CI": [ 4181 ],
  90844. "CO": [ 4213 ],
  90845. "I0": [ "0" ],
  90846. "I1": [ 4180 ]
  90847. }
  90848. },
  90849. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_4": {
  90850. "hide_name": 0,
  90851. "type": "SB_LUT4",
  90852. "parameters": {
  90853. "LUT_INIT": "0110100110010110"
  90854. },
  90855. "attributes": {
  90856. "module_not_derived": "00000000000000000000000000000001",
  90857. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90858. },
  90859. "port_directions": {
  90860. "I0": "input",
  90861. "I1": "input",
  90862. "I2": "input",
  90863. "I3": "input",
  90864. "O": "output"
  90865. },
  90866. "connections": {
  90867. "I0": [ "0" ],
  90868. "I1": [ "0" ],
  90869. "I2": [ 4215 ],
  90870. "I3": [ 4216 ],
  90871. "O": [ 4217 ]
  90872. }
  90873. },
  90874. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_4_I2_SB_LUT4_O": {
  90875. "hide_name": 0,
  90876. "type": "SB_LUT4",
  90877. "parameters": {
  90878. "LUT_INIT": "0000111111110000"
  90879. },
  90880. "attributes": {
  90881. "module_not_derived": "00000000000000000000000000000001",
  90882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90883. },
  90884. "port_directions": {
  90885. "I0": "input",
  90886. "I1": "input",
  90887. "I2": "input",
  90888. "I3": "input",
  90889. "O": "output"
  90890. },
  90891. "connections": {
  90892. "I0": [ "0" ],
  90893. "I1": [ "0" ],
  90894. "I2": [ 3657 ],
  90895. "I3": [ 4150 ],
  90896. "O": [ 4215 ]
  90897. }
  90898. },
  90899. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  90900. "hide_name": 0,
  90901. "type": "SB_CARRY",
  90902. "parameters": {
  90903. },
  90904. "attributes": {
  90905. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90906. },
  90907. "port_directions": {
  90908. "CI": "input",
  90909. "CO": "output",
  90910. "I0": "input",
  90911. "I1": "input"
  90912. },
  90913. "connections": {
  90914. "CI": [ 4213 ],
  90915. "CO": [ 4216 ],
  90916. "I0": [ "0" ],
  90917. "I1": [ 4212 ]
  90918. }
  90919. },
  90920. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_5": {
  90921. "hide_name": 0,
  90922. "type": "SB_LUT4",
  90923. "parameters": {
  90924. "LUT_INIT": "0110100110010110"
  90925. },
  90926. "attributes": {
  90927. "module_not_derived": "00000000000000000000000000000001",
  90928. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  90929. },
  90930. "port_directions": {
  90931. "I0": "input",
  90932. "I1": "input",
  90933. "I2": "input",
  90934. "I3": "input",
  90935. "O": "output"
  90936. },
  90937. "connections": {
  90938. "I0": [ "0" ],
  90939. "I1": [ "0" ],
  90940. "I2": [ 4218 ],
  90941. "I3": [ 4219 ],
  90942. "O": [ 4220 ]
  90943. }
  90944. },
  90945. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_5_I2_SB_LUT4_O": {
  90946. "hide_name": 0,
  90947. "type": "SB_LUT4",
  90948. "parameters": {
  90949. "LUT_INIT": "0000111111110000"
  90950. },
  90951. "attributes": {
  90952. "module_not_derived": "00000000000000000000000000000001",
  90953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  90954. },
  90955. "port_directions": {
  90956. "I0": "input",
  90957. "I1": "input",
  90958. "I2": "input",
  90959. "I3": "input",
  90960. "O": "output"
  90961. },
  90962. "connections": {
  90963. "I0": [ "0" ],
  90964. "I1": [ "0" ],
  90965. "I2": [ 2898 ],
  90966. "I3": [ 4150 ],
  90967. "O": [ 4218 ]
  90968. }
  90969. },
  90970. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  90971. "hide_name": 0,
  90972. "type": "SB_CARRY",
  90973. "parameters": {
  90974. },
  90975. "attributes": {
  90976. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  90977. },
  90978. "port_directions": {
  90979. "CI": "input",
  90980. "CO": "output",
  90981. "I0": "input",
  90982. "I1": "input"
  90983. },
  90984. "connections": {
  90985. "CI": [ 4216 ],
  90986. "CO": [ 4219 ],
  90987. "I0": [ "0" ],
  90988. "I1": [ 4215 ]
  90989. }
  90990. },
  90991. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_6": {
  90992. "hide_name": 0,
  90993. "type": "SB_LUT4",
  90994. "parameters": {
  90995. "LUT_INIT": "0110100110010110"
  90996. },
  90997. "attributes": {
  90998. "module_not_derived": "00000000000000000000000000000001",
  90999. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91000. },
  91001. "port_directions": {
  91002. "I0": "input",
  91003. "I1": "input",
  91004. "I2": "input",
  91005. "I3": "input",
  91006. "O": "output"
  91007. },
  91008. "connections": {
  91009. "I0": [ "0" ],
  91010. "I1": [ "0" ],
  91011. "I2": [ 4221 ],
  91012. "I3": [ 4222 ],
  91013. "O": [ 4223 ]
  91014. }
  91015. },
  91016. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_6_I2_SB_LUT4_O": {
  91017. "hide_name": 0,
  91018. "type": "SB_LUT4",
  91019. "parameters": {
  91020. "LUT_INIT": "0000111111110000"
  91021. },
  91022. "attributes": {
  91023. "module_not_derived": "00000000000000000000000000000001",
  91024. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91025. },
  91026. "port_directions": {
  91027. "I0": "input",
  91028. "I1": "input",
  91029. "I2": "input",
  91030. "I3": "input",
  91031. "O": "output"
  91032. },
  91033. "connections": {
  91034. "I0": [ "0" ],
  91035. "I1": [ "0" ],
  91036. "I2": [ 3664 ],
  91037. "I3": [ 4150 ],
  91038. "O": [ 4221 ]
  91039. }
  91040. },
  91041. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  91042. "hide_name": 0,
  91043. "type": "SB_CARRY",
  91044. "parameters": {
  91045. },
  91046. "attributes": {
  91047. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  91048. },
  91049. "port_directions": {
  91050. "CI": "input",
  91051. "CO": "output",
  91052. "I0": "input",
  91053. "I1": "input"
  91054. },
  91055. "connections": {
  91056. "CI": [ 4219 ],
  91057. "CO": [ 4222 ],
  91058. "I0": [ "0" ],
  91059. "I1": [ 4218 ]
  91060. }
  91061. },
  91062. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_7": {
  91063. "hide_name": 0,
  91064. "type": "SB_LUT4",
  91065. "parameters": {
  91066. "LUT_INIT": "0110100110010110"
  91067. },
  91068. "attributes": {
  91069. "module_not_derived": "00000000000000000000000000000001",
  91070. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91071. },
  91072. "port_directions": {
  91073. "I0": "input",
  91074. "I1": "input",
  91075. "I2": "input",
  91076. "I3": "input",
  91077. "O": "output"
  91078. },
  91079. "connections": {
  91080. "I0": [ "0" ],
  91081. "I1": [ "0" ],
  91082. "I2": [ 4224 ],
  91083. "I3": [ 4225 ],
  91084. "O": [ 4226 ]
  91085. }
  91086. },
  91087. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_7_I2_SB_LUT4_O": {
  91088. "hide_name": 0,
  91089. "type": "SB_LUT4",
  91090. "parameters": {
  91091. "LUT_INIT": "0000111111110000"
  91092. },
  91093. "attributes": {
  91094. "module_not_derived": "00000000000000000000000000000001",
  91095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91096. },
  91097. "port_directions": {
  91098. "I0": "input",
  91099. "I1": "input",
  91100. "I2": "input",
  91101. "I3": "input",
  91102. "O": "output"
  91103. },
  91104. "connections": {
  91105. "I0": [ "0" ],
  91106. "I1": [ "0" ],
  91107. "I2": [ 2913 ],
  91108. "I3": [ 4150 ],
  91109. "O": [ 4224 ]
  91110. }
  91111. },
  91112. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  91113. "hide_name": 0,
  91114. "type": "SB_CARRY",
  91115. "parameters": {
  91116. },
  91117. "attributes": {
  91118. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  91119. },
  91120. "port_directions": {
  91121. "CI": "input",
  91122. "CO": "output",
  91123. "I0": "input",
  91124. "I1": "input"
  91125. },
  91126. "connections": {
  91127. "CI": [ 4222 ],
  91128. "CO": [ 4225 ],
  91129. "I0": [ "0" ],
  91130. "I1": [ 4221 ]
  91131. }
  91132. },
  91133. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_8": {
  91134. "hide_name": 0,
  91135. "type": "SB_LUT4",
  91136. "parameters": {
  91137. "LUT_INIT": "0110100110010110"
  91138. },
  91139. "attributes": {
  91140. "module_not_derived": "00000000000000000000000000000001",
  91141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91142. },
  91143. "port_directions": {
  91144. "I0": "input",
  91145. "I1": "input",
  91146. "I2": "input",
  91147. "I3": "input",
  91148. "O": "output"
  91149. },
  91150. "connections": {
  91151. "I0": [ "0" ],
  91152. "I1": [ "0" ],
  91153. "I2": [ 4227 ],
  91154. "I3": [ 4228 ],
  91155. "O": [ 4229 ]
  91156. }
  91157. },
  91158. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_8_I2_SB_LUT4_O": {
  91159. "hide_name": 0,
  91160. "type": "SB_LUT4",
  91161. "parameters": {
  91162. "LUT_INIT": "0000111111110000"
  91163. },
  91164. "attributes": {
  91165. "module_not_derived": "00000000000000000000000000000001",
  91166. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91167. },
  91168. "port_directions": {
  91169. "I0": "input",
  91170. "I1": "input",
  91171. "I2": "input",
  91172. "I3": "input",
  91173. "O": "output"
  91174. },
  91175. "connections": {
  91176. "I0": [ "0" ],
  91177. "I1": [ "0" ],
  91178. "I2": [ 3676 ],
  91179. "I3": [ 4150 ],
  91180. "O": [ 4227 ]
  91181. }
  91182. },
  91183. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  91184. "hide_name": 0,
  91185. "type": "SB_CARRY",
  91186. "parameters": {
  91187. },
  91188. "attributes": {
  91189. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  91190. },
  91191. "port_directions": {
  91192. "CI": "input",
  91193. "CO": "output",
  91194. "I0": "input",
  91195. "I1": "input"
  91196. },
  91197. "connections": {
  91198. "CI": [ 4225 ],
  91199. "CO": [ 4228 ],
  91200. "I0": [ "0" ],
  91201. "I1": [ 4224 ]
  91202. }
  91203. },
  91204. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_9": {
  91205. "hide_name": 0,
  91206. "type": "SB_LUT4",
  91207. "parameters": {
  91208. "LUT_INIT": "0110100110010110"
  91209. },
  91210. "attributes": {
  91211. "module_not_derived": "00000000000000000000000000000001",
  91212. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91213. },
  91214. "port_directions": {
  91215. "I0": "input",
  91216. "I1": "input",
  91217. "I2": "input",
  91218. "I3": "input",
  91219. "O": "output"
  91220. },
  91221. "connections": {
  91222. "I0": [ "0" ],
  91223. "I1": [ "0" ],
  91224. "I2": [ 4152 ],
  91225. "I3": [ 4151 ],
  91226. "O": [ 4230 ]
  91227. }
  91228. },
  91229. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_9_I2_SB_LUT4_O": {
  91230. "hide_name": 0,
  91231. "type": "SB_LUT4",
  91232. "parameters": {
  91233. "LUT_INIT": "0000111111110000"
  91234. },
  91235. "attributes": {
  91236. "module_not_derived": "00000000000000000000000000000001",
  91237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91238. },
  91239. "port_directions": {
  91240. "I0": "input",
  91241. "I1": "input",
  91242. "I2": "input",
  91243. "I3": "input",
  91244. "O": "output"
  91245. },
  91246. "connections": {
  91247. "I0": [ "0" ],
  91248. "I1": [ "0" ],
  91249. "I2": [ 3674 ],
  91250. "I3": [ 4150 ],
  91251. "O": [ 4152 ]
  91252. }
  91253. },
  91254. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  91255. "hide_name": 0,
  91256. "type": "SB_CARRY",
  91257. "parameters": {
  91258. },
  91259. "attributes": {
  91260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  91261. },
  91262. "port_directions": {
  91263. "CI": "input",
  91264. "CO": "output",
  91265. "I0": "input",
  91266. "I1": "input"
  91267. },
  91268. "connections": {
  91269. "CI": [ 4228 ],
  91270. "CO": [ 4151 ],
  91271. "I0": [ "0" ],
  91272. "I1": [ 4227 ]
  91273. }
  91274. },
  91275. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_I2_SB_LUT4_O": {
  91276. "hide_name": 0,
  91277. "type": "SB_LUT4",
  91278. "parameters": {
  91279. "LUT_INIT": "0000111111110000"
  91280. },
  91281. "attributes": {
  91282. "module_not_derived": "00000000000000000000000000000001",
  91283. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91284. },
  91285. "port_directions": {
  91286. "I0": "input",
  91287. "I1": "input",
  91288. "I2": "input",
  91289. "I3": "input",
  91290. "O": "output"
  91291. },
  91292. "connections": {
  91293. "I0": [ "0" ],
  91294. "I1": [ "0" ],
  91295. "I2": [ 3641 ],
  91296. "I3": [ 4150 ],
  91297. "O": [ 4141 ]
  91298. }
  91299. },
  91300. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_I3_SB_CARRY_CO": {
  91301. "hide_name": 0,
  91302. "type": "SB_CARRY",
  91303. "parameters": {
  91304. },
  91305. "attributes": {
  91306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  91307. },
  91308. "port_directions": {
  91309. "CI": "input",
  91310. "CO": "output",
  91311. "I0": "input",
  91312. "I1": "input"
  91313. },
  91314. "connections": {
  91315. "CI": [ 4210 ],
  91316. "CO": [ 4142 ],
  91317. "I0": [ "0" ],
  91318. "I1": [ 4209 ]
  91319. }
  91320. },
  91321. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2": {
  91322. "hide_name": 0,
  91323. "type": "SB_LUT4",
  91324. "parameters": {
  91325. "LUT_INIT": "0011000000000000"
  91326. },
  91327. "attributes": {
  91328. "module_not_derived": "00000000000000000000000000000001",
  91329. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91330. },
  91331. "port_directions": {
  91332. "I0": "input",
  91333. "I1": "input",
  91334. "I2": "input",
  91335. "I3": "input",
  91336. "O": "output"
  91337. },
  91338. "connections": {
  91339. "I0": [ "0" ],
  91340. "I1": [ 3639 ],
  91341. "I2": [ 3985 ],
  91342. "I3": [ 4231 ],
  91343. "O": [ 4232 ]
  91344. }
  91345. },
  91346. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_I3_SB_LUT4_O": {
  91347. "hide_name": 0,
  91348. "type": "SB_LUT4",
  91349. "parameters": {
  91350. "LUT_INIT": "0000000000000001"
  91351. },
  91352. "attributes": {
  91353. "module_not_derived": "00000000000000000000000000000001",
  91354. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91355. },
  91356. "port_directions": {
  91357. "I0": "input",
  91358. "I1": "input",
  91359. "I2": "input",
  91360. "I3": "input",
  91361. "O": "output"
  91362. },
  91363. "connections": {
  91364. "I0": [ 3653 ],
  91365. "I1": [ 3650 ],
  91366. "I2": [ 3646 ],
  91367. "I3": [ 2535 ],
  91368. "O": [ 4231 ]
  91369. }
  91370. },
  91371. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O": {
  91372. "hide_name": 0,
  91373. "type": "SB_LUT4",
  91374. "parameters": {
  91375. "LUT_INIT": "1111000000000000"
  91376. },
  91377. "attributes": {
  91378. "module_not_derived": "00000000000000000000000000000001",
  91379. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91380. },
  91381. "port_directions": {
  91382. "I0": "input",
  91383. "I1": "input",
  91384. "I2": "input",
  91385. "I3": "input",
  91386. "O": "output"
  91387. },
  91388. "connections": {
  91389. "I0": [ "0" ],
  91390. "I1": [ "0" ],
  91391. "I2": [ 4233 ],
  91392. "I3": [ 4234 ],
  91393. "O": [ 4235 ]
  91394. }
  91395. },
  91396. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_1": {
  91397. "hide_name": 0,
  91398. "type": "SB_LUT4",
  91399. "parameters": {
  91400. "LUT_INIT": "1100000000000000"
  91401. },
  91402. "attributes": {
  91403. "module_not_derived": "00000000000000000000000000000001",
  91404. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91405. },
  91406. "port_directions": {
  91407. "I0": "input",
  91408. "I1": "input",
  91409. "I2": "input",
  91410. "I3": "input",
  91411. "O": "output"
  91412. },
  91413. "connections": {
  91414. "I0": [ "0" ],
  91415. "I1": [ 4236 ],
  91416. "I2": [ 4237 ],
  91417. "I3": [ 4238 ],
  91418. "O": [ 4239 ]
  91419. }
  91420. },
  91421. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_1_I1_SB_LUT4_O": {
  91422. "hide_name": 0,
  91423. "type": "SB_LUT4",
  91424. "parameters": {
  91425. "LUT_INIT": "0000000000000001"
  91426. },
  91427. "attributes": {
  91428. "module_not_derived": "00000000000000000000000000000001",
  91429. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91430. },
  91431. "port_directions": {
  91432. "I0": "input",
  91433. "I1": "input",
  91434. "I2": "input",
  91435. "I3": "input",
  91436. "O": "output"
  91437. },
  91438. "connections": {
  91439. "I0": [ 2954 ],
  91440. "I1": [ 3666 ],
  91441. "I2": [ 3668 ],
  91442. "I3": [ 2934 ],
  91443. "O": [ 4236 ]
  91444. }
  91445. },
  91446. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_1_I1_SB_LUT4_O_1": {
  91447. "hide_name": 0,
  91448. "type": "SB_LUT4",
  91449. "parameters": {
  91450. "LUT_INIT": "0000000000000001"
  91451. },
  91452. "attributes": {
  91453. "module_not_derived": "00000000000000000000000000000001",
  91454. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91455. },
  91456. "port_directions": {
  91457. "I0": "input",
  91458. "I1": "input",
  91459. "I2": "input",
  91460. "I3": "input",
  91461. "O": "output"
  91462. },
  91463. "connections": {
  91464. "I0": [ 3661 ],
  91465. "I1": [ 3658 ],
  91466. "I2": [ 3654 ],
  91467. "I3": [ 2996 ],
  91468. "O": [ 4237 ]
  91469. }
  91470. },
  91471. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_1_I1_SB_LUT4_O_2": {
  91472. "hide_name": 0,
  91473. "type": "SB_LUT4",
  91474. "parameters": {
  91475. "LUT_INIT": "0000000000000001"
  91476. },
  91477. "attributes": {
  91478. "module_not_derived": "00000000000000000000000000000001",
  91479. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91480. },
  91481. "port_directions": {
  91482. "I0": "input",
  91483. "I1": "input",
  91484. "I2": "input",
  91485. "I3": "input",
  91486. "O": "output"
  91487. },
  91488. "connections": {
  91489. "I0": [ 3647 ],
  91490. "I1": [ 3643 ],
  91491. "I2": [ 3016 ],
  91492. "I3": [ 3684 ],
  91493. "O": [ 4238 ]
  91494. }
  91495. },
  91496. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_2": {
  91497. "hide_name": 0,
  91498. "type": "SB_LUT4",
  91499. "parameters": {
  91500. "LUT_INIT": "1111000000000000"
  91501. },
  91502. "attributes": {
  91503. "module_not_derived": "00000000000000000000000000000001",
  91504. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91505. },
  91506. "port_directions": {
  91507. "I0": "input",
  91508. "I1": "input",
  91509. "I2": "input",
  91510. "I3": "input",
  91511. "O": "output"
  91512. },
  91513. "connections": {
  91514. "I0": [ "0" ],
  91515. "I1": [ "0" ],
  91516. "I2": [ 4240 ],
  91517. "I3": [ 4241 ],
  91518. "O": [ 4242 ]
  91519. }
  91520. },
  91521. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O": {
  91522. "hide_name": 0,
  91523. "type": "SB_LUT4",
  91524. "parameters": {
  91525. "LUT_INIT": "0000000000000001"
  91526. },
  91527. "attributes": {
  91528. "module_not_derived": "00000000000000000000000000000001",
  91529. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91530. },
  91531. "port_directions": {
  91532. "I0": "input",
  91533. "I1": "input",
  91534. "I2": "input",
  91535. "I3": "input",
  91536. "O": "output"
  91537. },
  91538. "connections": {
  91539. "I0": [ 3664 ],
  91540. "I1": [ 2898 ],
  91541. "I2": [ 3657 ],
  91542. "I3": [ 964 ],
  91543. "O": [ 4240 ]
  91544. }
  91545. },
  91546. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O_1": {
  91547. "hide_name": 0,
  91548. "type": "SB_LUT4",
  91549. "parameters": {
  91550. "LUT_INIT": "0000000000000001"
  91551. },
  91552. "attributes": {
  91553. "module_not_derived": "00000000000000000000000000000001",
  91554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91555. },
  91556. "port_directions": {
  91557. "I0": "input",
  91558. "I1": "input",
  91559. "I2": "input",
  91560. "I3": "input",
  91561. "O": "output"
  91562. },
  91563. "connections": {
  91564. "I0": [ 3672 ],
  91565. "I1": [ 3674 ],
  91566. "I2": [ 3676 ],
  91567. "I3": [ 2913 ],
  91568. "O": [ 4241 ]
  91569. }
  91570. },
  91571. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_I2_SB_LUT4_O": {
  91572. "hide_name": 0,
  91573. "type": "SB_LUT4",
  91574. "parameters": {
  91575. "LUT_INIT": "0000000000000001"
  91576. },
  91577. "attributes": {
  91578. "module_not_derived": "00000000000000000000000000000001",
  91579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91580. },
  91581. "port_directions": {
  91582. "I0": "input",
  91583. "I1": "input",
  91584. "I2": "input",
  91585. "I3": "input",
  91586. "O": "output"
  91587. },
  91588. "connections": {
  91589. "I0": [ 3061 ],
  91590. "I1": [ 3047 ],
  91591. "I2": [ 3036 ],
  91592. "I3": [ 3022 ],
  91593. "O": [ 4233 ]
  91594. }
  91595. },
  91596. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_I2_SB_LUT4_O_1": {
  91597. "hide_name": 0,
  91598. "type": "SB_LUT4",
  91599. "parameters": {
  91600. "LUT_INIT": "0000000000000001"
  91601. },
  91602. "attributes": {
  91603. "module_not_derived": "00000000000000000000000000000001",
  91604. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91605. },
  91606. "port_directions": {
  91607. "I0": "input",
  91608. "I1": "input",
  91609. "I2": "input",
  91610. "I3": "input",
  91611. "O": "output"
  91612. },
  91613. "connections": {
  91614. "I0": [ 2882 ],
  91615. "I1": [ 2870 ],
  91616. "I2": [ 3076 ],
  91617. "I3": [ 3641 ],
  91618. "O": [ 4234 ]
  91619. }
  91620. },
  91621. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I3": {
  91622. "hide_name": 0,
  91623. "type": "SB_LUT4",
  91624. "parameters": {
  91625. "LUT_INIT": "1111000000000000"
  91626. },
  91627. "attributes": {
  91628. "module_not_derived": "00000000000000000000000000000001",
  91629. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91630. },
  91631. "port_directions": {
  91632. "I0": "input",
  91633. "I1": "input",
  91634. "I2": "input",
  91635. "I3": "input",
  91636. "O": "output"
  91637. },
  91638. "connections": {
  91639. "I0": [ "0" ],
  91640. "I1": [ "0" ],
  91641. "I2": [ 3661 ],
  91642. "I3": [ 3985 ],
  91643. "O": [ 4150 ]
  91644. }
  91645. },
  91646. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_DFFE_Q": {
  91647. "hide_name": 0,
  91648. "type": "SB_DFFE",
  91649. "parameters": {
  91650. },
  91651. "attributes": {
  91652. "module_not_derived": "00000000000000000000000000000001",
  91653. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  91654. },
  91655. "port_directions": {
  91656. "C": "input",
  91657. "D": "input",
  91658. "E": "input",
  91659. "Q": "output"
  91660. },
  91661. "connections": {
  91662. "C": [ 42 ],
  91663. "D": [ 2591 ],
  91664. "E": [ 2263 ],
  91665. "Q": [ 3980 ]
  91666. }
  91667. },
  91668. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0": {
  91669. "hide_name": 0,
  91670. "type": "SB_LUT4",
  91671. "parameters": {
  91672. "LUT_INIT": "0000100000000000"
  91673. },
  91674. "attributes": {
  91675. "module_not_derived": "00000000000000000000000000000001",
  91676. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91677. },
  91678. "port_directions": {
  91679. "I0": "input",
  91680. "I1": "input",
  91681. "I2": "input",
  91682. "I3": "input",
  91683. "O": "output"
  91684. },
  91685. "connections": {
  91686. "I0": [ 3980 ],
  91687. "I1": [ 1241 ],
  91688. "I2": [ 1018 ],
  91689. "I3": [ 4243 ],
  91690. "O": [ 941 ]
  91691. }
  91692. },
  91693. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3": {
  91694. "hide_name": 0,
  91695. "type": "SB_LUT4",
  91696. "parameters": {
  91697. "LUT_INIT": "1111110000000000"
  91698. },
  91699. "attributes": {
  91700. "module_not_derived": "00000000000000000000000000000001",
  91701. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91702. },
  91703. "port_directions": {
  91704. "I0": "input",
  91705. "I1": "input",
  91706. "I2": "input",
  91707. "I3": "input",
  91708. "O": "output"
  91709. },
  91710. "connections": {
  91711. "I0": [ "0" ],
  91712. "I1": [ 1013 ],
  91713. "I2": [ 944 ],
  91714. "I3": [ 4243 ],
  91715. "O": [ 1478 ]
  91716. }
  91717. },
  91718. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1": {
  91719. "hide_name": 0,
  91720. "type": "SB_LUT4",
  91721. "parameters": {
  91722. "LUT_INIT": "0000111100000000"
  91723. },
  91724. "attributes": {
  91725. "module_not_derived": "00000000000000000000000000000001",
  91726. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91727. },
  91728. "port_directions": {
  91729. "I0": "input",
  91730. "I1": "input",
  91731. "I2": "input",
  91732. "I3": "input",
  91733. "O": "output"
  91734. },
  91735. "connections": {
  91736. "I0": [ "0" ],
  91737. "I1": [ "0" ],
  91738. "I2": [ 944 ],
  91739. "I3": [ 4243 ],
  91740. "O": [ 1469 ]
  91741. }
  91742. },
  91743. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  91744. "hide_name": 0,
  91745. "type": "SB_LUT4",
  91746. "parameters": {
  91747. "LUT_INIT": "0000000011110000"
  91748. },
  91749. "attributes": {
  91750. "module_not_derived": "00000000000000000000000000000001",
  91751. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91752. },
  91753. "port_directions": {
  91754. "I0": "input",
  91755. "I1": "input",
  91756. "I2": "input",
  91757. "I3": "input",
  91758. "O": "output"
  91759. },
  91760. "connections": {
  91761. "I0": [ "0" ],
  91762. "I1": [ "0" ],
  91763. "I2": [ 1469 ],
  91764. "I3": [ 4244 ],
  91765. "O": [ 3978 ]
  91766. }
  91767. },
  91768. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_I3_SB_LUT4_O": {
  91769. "hide_name": 0,
  91770. "type": "SB_LUT4",
  91771. "parameters": {
  91772. "LUT_INIT": "0001001101011111"
  91773. },
  91774. "attributes": {
  91775. "module_not_derived": "00000000000000000000000000000001",
  91776. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91777. },
  91778. "port_directions": {
  91779. "I0": "input",
  91780. "I1": "input",
  91781. "I2": "input",
  91782. "I3": "input",
  91783. "O": "output"
  91784. },
  91785. "connections": {
  91786. "I0": [ 1241 ],
  91787. "I1": [ 1365 ],
  91788. "I2": [ 1020 ],
  91789. "I3": [ 1475 ],
  91790. "O": [ 4244 ]
  91791. }
  91792. },
  91793. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3": {
  91794. "hide_name": 0,
  91795. "type": "SB_LUT4",
  91796. "parameters": {
  91797. "LUT_INIT": "0000110000000000"
  91798. },
  91799. "attributes": {
  91800. "module_not_derived": "00000000000000000000000000000001",
  91801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91802. },
  91803. "port_directions": {
  91804. "I0": "input",
  91805. "I1": "input",
  91806. "I2": "input",
  91807. "I3": "input",
  91808. "O": "output"
  91809. },
  91810. "connections": {
  91811. "I0": [ "0" ],
  91812. "I1": [ 1241 ],
  91813. "I2": [ 1020 ],
  91814. "I3": [ 1469 ],
  91815. "O": [ 4245 ]
  91816. }
  91817. },
  91818. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_1": {
  91819. "hide_name": 0,
  91820. "type": "SB_LUT4",
  91821. "parameters": {
  91822. "LUT_INIT": "1100000000000000"
  91823. },
  91824. "attributes": {
  91825. "module_not_derived": "00000000000000000000000000000001",
  91826. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91827. },
  91828. "port_directions": {
  91829. "I0": "input",
  91830. "I1": "input",
  91831. "I2": "input",
  91832. "I3": "input",
  91833. "O": "output"
  91834. },
  91835. "connections": {
  91836. "I0": [ "0" ],
  91837. "I1": [ 1154 ],
  91838. "I2": [ 1365 ],
  91839. "I3": [ 1469 ],
  91840. "O": [ 1015 ]
  91841. }
  91842. },
  91843. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_LUT4_I3": {
  91844. "hide_name": 0,
  91845. "type": "SB_LUT4",
  91846. "parameters": {
  91847. "LUT_INIT": "1111111100001100"
  91848. },
  91849. "attributes": {
  91850. "module_not_derived": "00000000000000000000000000000001",
  91851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91852. },
  91853. "port_directions": {
  91854. "I0": "input",
  91855. "I1": "input",
  91856. "I2": "input",
  91857. "I3": "input",
  91858. "O": "output"
  91859. },
  91860. "connections": {
  91861. "I0": [ "0" ],
  91862. "I1": [ 1018 ],
  91863. "I2": [ 1023 ],
  91864. "I3": [ 4245 ],
  91865. "O": [ 4246 ]
  91866. }
  91867. },
  91868. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_DFFR_D": {
  91869. "hide_name": 0,
  91870. "type": "SB_DFFR",
  91871. "parameters": {
  91872. },
  91873. "attributes": {
  91874. "module_not_derived": "00000000000000000000000000000001",
  91875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  91876. },
  91877. "port_directions": {
  91878. "C": "input",
  91879. "D": "input",
  91880. "Q": "output",
  91881. "R": "input"
  91882. },
  91883. "connections": {
  91884. "C": [ 42 ],
  91885. "D": [ 4246 ],
  91886. "Q": [ 3090 ],
  91887. "R": [ 127 ]
  91888. }
  91889. },
  91890. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_DFFR_D_Q_SB_LUT4_I1": {
  91891. "hide_name": 0,
  91892. "type": "SB_LUT4",
  91893. "parameters": {
  91894. "LUT_INIT": "0001111100000000"
  91895. },
  91896. "attributes": {
  91897. "module_not_derived": "00000000000000000000000000000001",
  91898. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91899. },
  91900. "port_directions": {
  91901. "I0": "input",
  91902. "I1": "input",
  91903. "I2": "input",
  91904. "I3": "input",
  91905. "O": "output"
  91906. },
  91907. "connections": {
  91908. "I0": [ 2326 ],
  91909. "I1": [ 3090 ],
  91910. "I2": [ 2858 ],
  91911. "I3": [ 3982 ],
  91912. "O": [ 2263 ]
  91913. }
  91914. },
  91915. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I1": {
  91916. "hide_name": 0,
  91917. "type": "SB_LUT4",
  91918. "parameters": {
  91919. "LUT_INIT": "1100111111001100"
  91920. },
  91921. "attributes": {
  91922. "module_not_derived": "00000000000000000000000000000001",
  91923. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  91924. },
  91925. "port_directions": {
  91926. "I0": "input",
  91927. "I1": "input",
  91928. "I2": "input",
  91929. "I3": "input",
  91930. "O": "output"
  91931. },
  91932. "connections": {
  91933. "I0": [ "0" ],
  91934. "I1": [ 4247 ],
  91935. "I2": [ 1020 ],
  91936. "I3": [ 1478 ],
  91937. "O": [ 4248 ]
  91938. }
  91939. },
  91940. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I1_O_SB_DFFR_D": {
  91941. "hide_name": 0,
  91942. "type": "SB_DFFR",
  91943. "parameters": {
  91944. },
  91945. "attributes": {
  91946. "module_not_derived": "00000000000000000000000000000001",
  91947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  91948. },
  91949. "port_directions": {
  91950. "C": "input",
  91951. "D": "input",
  91952. "Q": "output",
  91953. "R": "input"
  91954. },
  91955. "connections": {
  91956. "C": [ 42 ],
  91957. "D": [ 4248 ],
  91958. "Q": [ 1022 ],
  91959. "R": [ 127 ]
  91960. }
  91961. },
  91962. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O": {
  91963. "hide_name": 0,
  91964. "type": "SB_LUT4",
  91965. "parameters": {
  91966. "LUT_INIT": "0000000000100000"
  91967. },
  91968. "attributes": {
  91969. "module_not_derived": "00000000000000000000000000000001",
  91970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  91971. },
  91972. "port_directions": {
  91973. "I0": "input",
  91974. "I1": "input",
  91975. "I2": "input",
  91976. "I3": "input",
  91977. "O": "output"
  91978. },
  91979. "connections": {
  91980. "I0": [ 1154 ],
  91981. "I1": [ 1009 ],
  91982. "I2": [ 1011 ],
  91983. "I3": [ 1013 ],
  91984. "O": [ 1024 ]
  91985. }
  91986. },
  91987. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I3": {
  91988. "hide_name": 0,
  91989. "type": "SB_LUT4",
  91990. "parameters": {
  91991. "LUT_INIT": "1111000000000000"
  91992. },
  91993. "attributes": {
  91994. "module_not_derived": "00000000000000000000000000000001",
  91995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  91996. },
  91997. "port_directions": {
  91998. "I0": "input",
  91999. "I1": "input",
  92000. "I2": "input",
  92001. "I3": "input",
  92002. "O": "output"
  92003. },
  92004. "connections": {
  92005. "I0": [ "0" ],
  92006. "I1": [ "0" ],
  92007. "I2": [ 1020 ],
  92008. "I3": [ 1478 ],
  92009. "O": [ 1012 ]
  92010. }
  92011. },
  92012. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  92013. "hide_name": 0,
  92014. "type": "SB_LUT4",
  92015. "parameters": {
  92016. "LUT_INIT": "0000000011000000"
  92017. },
  92018. "attributes": {
  92019. "module_not_derived": "00000000000000000000000000000001",
  92020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  92021. },
  92022. "port_directions": {
  92023. "I0": "input",
  92024. "I1": "input",
  92025. "I2": "input",
  92026. "I3": "input",
  92027. "O": "output"
  92028. },
  92029. "connections": {
  92030. "I0": [ "0" ],
  92031. "I1": [ 1022 ],
  92032. "I2": [ 1018 ],
  92033. "I3": [ 1023 ],
  92034. "O": [ 4247 ]
  92035. }
  92036. },
  92037. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_O": {
  92038. "hide_name": 0,
  92039. "type": "SB_LUT4",
  92040. "parameters": {
  92041. "LUT_INIT": "0000000000001111"
  92042. },
  92043. "attributes": {
  92044. "module_not_derived": "00000000000000000000000000000001",
  92045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  92046. },
  92047. "port_directions": {
  92048. "I0": "input",
  92049. "I1": "input",
  92050. "I2": "input",
  92051. "I3": "input",
  92052. "O": "output"
  92053. },
  92054. "connections": {
  92055. "I0": [ "0" ],
  92056. "I1": [ "0" ],
  92057. "I2": [ 1391 ],
  92058. "I3": [ 1023 ],
  92059. "O": [ 4243 ]
  92060. }
  92061. },
  92062. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_O_SB_LUT4_I3": {
  92063. "hide_name": 0,
  92064. "type": "SB_LUT4",
  92065. "parameters": {
  92066. "LUT_INIT": "1000110010111111"
  92067. },
  92068. "attributes": {
  92069. "module_not_derived": "00000000000000000000000000000001",
  92070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92071. },
  92072. "port_directions": {
  92073. "I0": "input",
  92074. "I1": "input",
  92075. "I2": "input",
  92076. "I3": "input",
  92077. "O": "output"
  92078. },
  92079. "connections": {
  92080. "I0": [ 914 ],
  92081. "I1": [ 740 ],
  92082. "I2": [ 937 ],
  92083. "I3": [ 941 ],
  92084. "O": [ 3983 ]
  92085. }
  92086. },
  92087. "cpu_I.decode_to_execute_PC_SB_DFFE_Q": {
  92088. "hide_name": 0,
  92089. "type": "SB_DFFE",
  92090. "parameters": {
  92091. },
  92092. "attributes": {
  92093. "module_not_derived": "00000000000000000000000000000001",
  92094. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92095. },
  92096. "port_directions": {
  92097. "C": "input",
  92098. "D": "input",
  92099. "E": "input",
  92100. "Q": "output"
  92101. },
  92102. "connections": {
  92103. "C": [ 42 ],
  92104. "D": [ 1483 ],
  92105. "E": [ 2263 ],
  92106. "Q": [ 4249 ]
  92107. }
  92108. },
  92109. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_1": {
  92110. "hide_name": 0,
  92111. "type": "SB_DFFE",
  92112. "parameters": {
  92113. },
  92114. "attributes": {
  92115. "module_not_derived": "00000000000000000000000000000001",
  92116. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92117. },
  92118. "port_directions": {
  92119. "C": "input",
  92120. "D": "input",
  92121. "E": "input",
  92122. "Q": "output"
  92123. },
  92124. "connections": {
  92125. "C": [ 42 ],
  92126. "D": [ 1485 ],
  92127. "E": [ 2263 ],
  92128. "Q": [ 4250 ]
  92129. }
  92130. },
  92131. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_10": {
  92132. "hide_name": 0,
  92133. "type": "SB_DFFE",
  92134. "parameters": {
  92135. },
  92136. "attributes": {
  92137. "module_not_derived": "00000000000000000000000000000001",
  92138. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92139. },
  92140. "port_directions": {
  92141. "C": "input",
  92142. "D": "input",
  92143. "E": "input",
  92144. "Q": "output"
  92145. },
  92146. "connections": {
  92147. "C": [ 42 ],
  92148. "D": [ 1487 ],
  92149. "E": [ 2263 ],
  92150. "Q": [ 4251 ]
  92151. }
  92152. },
  92153. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_11": {
  92154. "hide_name": 0,
  92155. "type": "SB_DFFE",
  92156. "parameters": {
  92157. },
  92158. "attributes": {
  92159. "module_not_derived": "00000000000000000000000000000001",
  92160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92161. },
  92162. "port_directions": {
  92163. "C": "input",
  92164. "D": "input",
  92165. "E": "input",
  92166. "Q": "output"
  92167. },
  92168. "connections": {
  92169. "C": [ 42 ],
  92170. "D": [ 1489 ],
  92171. "E": [ 2263 ],
  92172. "Q": [ 2932 ]
  92173. }
  92174. },
  92175. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_12": {
  92176. "hide_name": 0,
  92177. "type": "SB_DFFE",
  92178. "parameters": {
  92179. },
  92180. "attributes": {
  92181. "module_not_derived": "00000000000000000000000000000001",
  92182. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92183. },
  92184. "port_directions": {
  92185. "C": "input",
  92186. "D": "input",
  92187. "E": "input",
  92188. "Q": "output"
  92189. },
  92190. "connections": {
  92191. "C": [ 42 ],
  92192. "D": [ 1491 ],
  92193. "E": [ 2263 ],
  92194. "Q": [ 4252 ]
  92195. }
  92196. },
  92197. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_13": {
  92198. "hide_name": 0,
  92199. "type": "SB_DFFE",
  92200. "parameters": {
  92201. },
  92202. "attributes": {
  92203. "module_not_derived": "00000000000000000000000000000001",
  92204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92205. },
  92206. "port_directions": {
  92207. "C": "input",
  92208. "D": "input",
  92209. "E": "input",
  92210. "Q": "output"
  92211. },
  92212. "connections": {
  92213. "C": [ 42 ],
  92214. "D": [ 1493 ],
  92215. "E": [ 2263 ],
  92216. "Q": [ 4253 ]
  92217. }
  92218. },
  92219. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_14": {
  92220. "hide_name": 0,
  92221. "type": "SB_DFFE",
  92222. "parameters": {
  92223. },
  92224. "attributes": {
  92225. "module_not_derived": "00000000000000000000000000000001",
  92226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92227. },
  92228. "port_directions": {
  92229. "C": "input",
  92230. "D": "input",
  92231. "E": "input",
  92232. "Q": "output"
  92233. },
  92234. "connections": {
  92235. "C": [ 42 ],
  92236. "D": [ 1495 ],
  92237. "E": [ 2263 ],
  92238. "Q": [ 4254 ]
  92239. }
  92240. },
  92241. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_15": {
  92242. "hide_name": 0,
  92243. "type": "SB_DFFE",
  92244. "parameters": {
  92245. },
  92246. "attributes": {
  92247. "module_not_derived": "00000000000000000000000000000001",
  92248. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92249. },
  92250. "port_directions": {
  92251. "C": "input",
  92252. "D": "input",
  92253. "E": "input",
  92254. "Q": "output"
  92255. },
  92256. "connections": {
  92257. "C": [ 42 ],
  92258. "D": [ 1497 ],
  92259. "E": [ 2263 ],
  92260. "Q": [ 2911 ]
  92261. }
  92262. },
  92263. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_16": {
  92264. "hide_name": 0,
  92265. "type": "SB_DFFE",
  92266. "parameters": {
  92267. },
  92268. "attributes": {
  92269. "module_not_derived": "00000000000000000000000000000001",
  92270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92271. },
  92272. "port_directions": {
  92273. "C": "input",
  92274. "D": "input",
  92275. "E": "input",
  92276. "Q": "output"
  92277. },
  92278. "connections": {
  92279. "C": [ 42 ],
  92280. "D": [ 1499 ],
  92281. "E": [ 2263 ],
  92282. "Q": [ 4255 ]
  92283. }
  92284. },
  92285. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_17": {
  92286. "hide_name": 0,
  92287. "type": "SB_DFFE",
  92288. "parameters": {
  92289. },
  92290. "attributes": {
  92291. "module_not_derived": "00000000000000000000000000000001",
  92292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92293. },
  92294. "port_directions": {
  92295. "C": "input",
  92296. "D": "input",
  92297. "E": "input",
  92298. "Q": "output"
  92299. },
  92300. "connections": {
  92301. "C": [ 42 ],
  92302. "D": [ 1501 ],
  92303. "E": [ 2263 ],
  92304. "Q": [ 2896 ]
  92305. }
  92306. },
  92307. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_18": {
  92308. "hide_name": 0,
  92309. "type": "SB_DFFE",
  92310. "parameters": {
  92311. },
  92312. "attributes": {
  92313. "module_not_derived": "00000000000000000000000000000001",
  92314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92315. },
  92316. "port_directions": {
  92317. "C": "input",
  92318. "D": "input",
  92319. "E": "input",
  92320. "Q": "output"
  92321. },
  92322. "connections": {
  92323. "C": [ 42 ],
  92324. "D": [ 1503 ],
  92325. "E": [ 2263 ],
  92326. "Q": [ 4256 ]
  92327. }
  92328. },
  92329. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_19": {
  92330. "hide_name": 0,
  92331. "type": "SB_DFFE",
  92332. "parameters": {
  92333. },
  92334. "attributes": {
  92335. "module_not_derived": "00000000000000000000000000000001",
  92336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92337. },
  92338. "port_directions": {
  92339. "C": "input",
  92340. "D": "input",
  92341. "E": "input",
  92342. "Q": "output"
  92343. },
  92344. "connections": {
  92345. "C": [ 42 ],
  92346. "D": [ 1505 ],
  92347. "E": [ 2263 ],
  92348. "Q": [ 2880 ]
  92349. }
  92350. },
  92351. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_2": {
  92352. "hide_name": 0,
  92353. "type": "SB_DFFE",
  92354. "parameters": {
  92355. },
  92356. "attributes": {
  92357. "module_not_derived": "00000000000000000000000000000001",
  92358. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92359. },
  92360. "port_directions": {
  92361. "C": "input",
  92362. "D": "input",
  92363. "E": "input",
  92364. "Q": "output"
  92365. },
  92366. "connections": {
  92367. "C": [ 42 ],
  92368. "D": [ 1507 ],
  92369. "E": [ 2263 ],
  92370. "Q": [ 4257 ]
  92371. }
  92372. },
  92373. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_20": {
  92374. "hide_name": 0,
  92375. "type": "SB_DFFE",
  92376. "parameters": {
  92377. },
  92378. "attributes": {
  92379. "module_not_derived": "00000000000000000000000000000001",
  92380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92381. },
  92382. "port_directions": {
  92383. "C": "input",
  92384. "D": "input",
  92385. "E": "input",
  92386. "Q": "output"
  92387. },
  92388. "connections": {
  92389. "C": [ 42 ],
  92390. "D": [ 1509 ],
  92391. "E": [ 2263 ],
  92392. "Q": [ 2867 ]
  92393. }
  92394. },
  92395. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_21": {
  92396. "hide_name": 0,
  92397. "type": "SB_DFFE",
  92398. "parameters": {
  92399. },
  92400. "attributes": {
  92401. "module_not_derived": "00000000000000000000000000000001",
  92402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92403. },
  92404. "port_directions": {
  92405. "C": "input",
  92406. "D": "input",
  92407. "E": "input",
  92408. "Q": "output"
  92409. },
  92410. "connections": {
  92411. "C": [ 42 ],
  92412. "D": [ 1432 ],
  92413. "E": [ 2263 ],
  92414. "Q": [ 3074 ]
  92415. }
  92416. },
  92417. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_22": {
  92418. "hide_name": 0,
  92419. "type": "SB_DFFE",
  92420. "parameters": {
  92421. },
  92422. "attributes": {
  92423. "module_not_derived": "00000000000000000000000000000001",
  92424. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92425. },
  92426. "port_directions": {
  92427. "C": "input",
  92428. "D": "input",
  92429. "E": "input",
  92430. "Q": "output"
  92431. },
  92432. "connections": {
  92433. "C": [ 42 ],
  92434. "D": [ 1377 ],
  92435. "E": [ 2263 ],
  92436. "Q": [ 4258 ]
  92437. }
  92438. },
  92439. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_23": {
  92440. "hide_name": 0,
  92441. "type": "SB_DFFE",
  92442. "parameters": {
  92443. },
  92444. "attributes": {
  92445. "module_not_derived": "00000000000000000000000000000001",
  92446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92447. },
  92448. "port_directions": {
  92449. "C": "input",
  92450. "D": "input",
  92451. "E": "input",
  92452. "Q": "output"
  92453. },
  92454. "connections": {
  92455. "C": [ 42 ],
  92456. "D": [ 1394 ],
  92457. "E": [ 2263 ],
  92458. "Q": [ 3059 ]
  92459. }
  92460. },
  92461. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_24": {
  92462. "hide_name": 0,
  92463. "type": "SB_DFFE",
  92464. "parameters": {
  92465. },
  92466. "attributes": {
  92467. "module_not_derived": "00000000000000000000000000000001",
  92468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92469. },
  92470. "port_directions": {
  92471. "C": "input",
  92472. "D": "input",
  92473. "E": "input",
  92474. "Q": "output"
  92475. },
  92476. "connections": {
  92477. "C": [ 42 ],
  92478. "D": [ 1404 ],
  92479. "E": [ 2263 ],
  92480. "Q": [ 3045 ]
  92481. }
  92482. },
  92483. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_25": {
  92484. "hide_name": 0,
  92485. "type": "SB_DFFE",
  92486. "parameters": {
  92487. },
  92488. "attributes": {
  92489. "module_not_derived": "00000000000000000000000000000001",
  92490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92491. },
  92492. "port_directions": {
  92493. "C": "input",
  92494. "D": "input",
  92495. "E": "input",
  92496. "Q": "output"
  92497. },
  92498. "connections": {
  92499. "C": [ 42 ],
  92500. "D": [ 1414 ],
  92501. "E": [ 2263 ],
  92502. "Q": [ 3034 ]
  92503. }
  92504. },
  92505. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_26": {
  92506. "hide_name": 0,
  92507. "type": "SB_DFFE",
  92508. "parameters": {
  92509. },
  92510. "attributes": {
  92511. "module_not_derived": "00000000000000000000000000000001",
  92512. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92513. },
  92514. "port_directions": {
  92515. "C": "input",
  92516. "D": "input",
  92517. "E": "input",
  92518. "Q": "output"
  92519. },
  92520. "connections": {
  92521. "C": [ 42 ],
  92522. "D": [ 1422 ],
  92523. "E": [ 2263 ],
  92524. "Q": [ 3014 ]
  92525. }
  92526. },
  92527. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_27": {
  92528. "hide_name": 0,
  92529. "type": "SB_DFFE",
  92530. "parameters": {
  92531. },
  92532. "attributes": {
  92533. "module_not_derived": "00000000000000000000000000000001",
  92534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92535. },
  92536. "port_directions": {
  92537. "C": "input",
  92538. "D": "input",
  92539. "E": "input",
  92540. "Q": "output"
  92541. },
  92542. "connections": {
  92543. "C": [ 42 ],
  92544. "D": [ 1446 ],
  92545. "E": [ 2263 ],
  92546. "Q": [ 4259 ]
  92547. }
  92548. },
  92549. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_28": {
  92550. "hide_name": 0,
  92551. "type": "SB_DFFE",
  92552. "parameters": {
  92553. },
  92554. "attributes": {
  92555. "module_not_derived": "00000000000000000000000000000001",
  92556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92557. },
  92558. "port_directions": {
  92559. "C": "input",
  92560. "D": "input",
  92561. "E": "input",
  92562. "Q": "output"
  92563. },
  92564. "connections": {
  92565. "C": [ 42 ],
  92566. "D": [ 1457 ],
  92567. "E": [ 2263 ],
  92568. "Q": [ 4260 ]
  92569. }
  92570. },
  92571. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_29": {
  92572. "hide_name": 0,
  92573. "type": "SB_DFFE",
  92574. "parameters": {
  92575. },
  92576. "attributes": {
  92577. "module_not_derived": "00000000000000000000000000000001",
  92578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92579. },
  92580. "port_directions": {
  92581. "C": "input",
  92582. "D": "input",
  92583. "E": "input",
  92584. "Q": "output"
  92585. },
  92586. "connections": {
  92587. "C": [ 42 ],
  92588. "D": [ 1461 ],
  92589. "E": [ 2263 ],
  92590. "Q": [ 4261 ]
  92591. }
  92592. },
  92593. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_3": {
  92594. "hide_name": 0,
  92595. "type": "SB_DFFE",
  92596. "parameters": {
  92597. },
  92598. "attributes": {
  92599. "module_not_derived": "00000000000000000000000000000001",
  92600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92601. },
  92602. "port_directions": {
  92603. "C": "input",
  92604. "D": "input",
  92605. "E": "input",
  92606. "Q": "output"
  92607. },
  92608. "connections": {
  92609. "C": [ 42 ],
  92610. "D": [ 1511 ],
  92611. "E": [ 2263 ],
  92612. "Q": [ 2994 ]
  92613. }
  92614. },
  92615. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_4": {
  92616. "hide_name": 0,
  92617. "type": "SB_DFFE",
  92618. "parameters": {
  92619. },
  92620. "attributes": {
  92621. "module_not_derived": "00000000000000000000000000000001",
  92622. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92623. },
  92624. "port_directions": {
  92625. "C": "input",
  92626. "D": "input",
  92627. "E": "input",
  92628. "Q": "output"
  92629. },
  92630. "connections": {
  92631. "C": [ 42 ],
  92632. "D": [ 1513 ],
  92633. "E": [ 2263 ],
  92634. "Q": [ 4262 ]
  92635. }
  92636. },
  92637. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_5": {
  92638. "hide_name": 0,
  92639. "type": "SB_DFFE",
  92640. "parameters": {
  92641. },
  92642. "attributes": {
  92643. "module_not_derived": "00000000000000000000000000000001",
  92644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92645. },
  92646. "port_directions": {
  92647. "C": "input",
  92648. "D": "input",
  92649. "E": "input",
  92650. "Q": "output"
  92651. },
  92652. "connections": {
  92653. "C": [ 42 ],
  92654. "D": [ 1515 ],
  92655. "E": [ 2263 ],
  92656. "Q": [ 4263 ]
  92657. }
  92658. },
  92659. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_6": {
  92660. "hide_name": 0,
  92661. "type": "SB_DFFE",
  92662. "parameters": {
  92663. },
  92664. "attributes": {
  92665. "module_not_derived": "00000000000000000000000000000001",
  92666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92667. },
  92668. "port_directions": {
  92669. "C": "input",
  92670. "D": "input",
  92671. "E": "input",
  92672. "Q": "output"
  92673. },
  92674. "connections": {
  92675. "C": [ 42 ],
  92676. "D": [ 1517 ],
  92677. "E": [ 2263 ],
  92678. "Q": [ 4264 ]
  92679. }
  92680. },
  92681. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_7": {
  92682. "hide_name": 0,
  92683. "type": "SB_DFFE",
  92684. "parameters": {
  92685. },
  92686. "attributes": {
  92687. "module_not_derived": "00000000000000000000000000000001",
  92688. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92689. },
  92690. "port_directions": {
  92691. "C": "input",
  92692. "D": "input",
  92693. "E": "input",
  92694. "Q": "output"
  92695. },
  92696. "connections": {
  92697. "C": [ 42 ],
  92698. "D": [ 1519 ],
  92699. "E": [ 2263 ],
  92700. "Q": [ 4265 ]
  92701. }
  92702. },
  92703. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_8": {
  92704. "hide_name": 0,
  92705. "type": "SB_DFFE",
  92706. "parameters": {
  92707. },
  92708. "attributes": {
  92709. "module_not_derived": "00000000000000000000000000000001",
  92710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92711. },
  92712. "port_directions": {
  92713. "C": "input",
  92714. "D": "input",
  92715. "E": "input",
  92716. "Q": "output"
  92717. },
  92718. "connections": {
  92719. "C": [ 42 ],
  92720. "D": [ 1521 ],
  92721. "E": [ 2263 ],
  92722. "Q": [ 2952 ]
  92723. }
  92724. },
  92725. "cpu_I.decode_to_execute_PC_SB_DFFE_Q_9": {
  92726. "hide_name": 0,
  92727. "type": "SB_DFFE",
  92728. "parameters": {
  92729. },
  92730. "attributes": {
  92731. "module_not_derived": "00000000000000000000000000000001",
  92732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92733. },
  92734. "port_directions": {
  92735. "C": "input",
  92736. "D": "input",
  92737. "E": "input",
  92738. "Q": "output"
  92739. },
  92740. "connections": {
  92741. "C": [ 42 ],
  92742. "D": [ 1523 ],
  92743. "E": [ 2263 ],
  92744. "Q": [ 4266 ]
  92745. }
  92746. },
  92747. "cpu_I.decode_to_execute_PREDICTION_HAD_BRANCHED2_SB_DFFE_Q": {
  92748. "hide_name": 0,
  92749. "type": "SB_DFFE",
  92750. "parameters": {
  92751. },
  92752. "attributes": {
  92753. "module_not_derived": "00000000000000000000000000000001",
  92754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  92755. },
  92756. "port_directions": {
  92757. "C": "input",
  92758. "D": "input",
  92759. "E": "input",
  92760. "Q": "output"
  92761. },
  92762. "connections": {
  92763. "C": [ 42 ],
  92764. "D": [ 1815 ],
  92765. "E": [ 2263 ],
  92766. "Q": [ 4267 ]
  92767. }
  92768. },
  92769. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_DFFESR_Q": {
  92770. "hide_name": 0,
  92771. "type": "SB_DFFESR",
  92772. "parameters": {
  92773. },
  92774. "attributes": {
  92775. "module_not_derived": "00000000000000000000000000000001",
  92776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  92777. },
  92778. "port_directions": {
  92779. "C": "input",
  92780. "D": "input",
  92781. "E": "input",
  92782. "Q": "output",
  92783. "R": "input"
  92784. },
  92785. "connections": {
  92786. "C": [ 42 ],
  92787. "D": [ 2590 ],
  92788. "E": [ 2263 ],
  92789. "Q": [ 4268 ],
  92790. "R": [ 2855 ]
  92791. }
  92792. },
  92793. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2": {
  92794. "hide_name": 0,
  92795. "type": "SB_LUT4",
  92796. "parameters": {
  92797. "LUT_INIT": "1101000000000000"
  92798. },
  92799. "attributes": {
  92800. "module_not_derived": "00000000000000000000000000000001",
  92801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92802. },
  92803. "port_directions": {
  92804. "I0": "input",
  92805. "I1": "input",
  92806. "I2": "input",
  92807. "I3": "input",
  92808. "O": "output"
  92809. },
  92810. "connections": {
  92811. "I0": [ 1549 ],
  92812. "I1": [ 970 ],
  92813. "I2": [ 4268 ],
  92814. "I3": [ 1241 ],
  92815. "O": [ 4269 ]
  92816. }
  92817. },
  92818. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_1": {
  92819. "hide_name": 0,
  92820. "type": "SB_LUT4",
  92821. "parameters": {
  92822. "LUT_INIT": "1011000000000000"
  92823. },
  92824. "attributes": {
  92825. "module_not_derived": "00000000000000000000000000000001",
  92826. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92827. },
  92828. "port_directions": {
  92829. "I0": "input",
  92830. "I1": "input",
  92831. "I2": "input",
  92832. "I3": "input",
  92833. "O": "output"
  92834. },
  92835. "connections": {
  92836. "I0": [ 1531 ],
  92837. "I1": [ 970 ],
  92838. "I2": [ 4268 ],
  92839. "I3": [ 1241 ],
  92840. "O": [ 4270 ]
  92841. }
  92842. },
  92843. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_1_O_SB_LUT4_I2": {
  92844. "hide_name": 0,
  92845. "type": "SB_LUT4",
  92846. "parameters": {
  92847. "LUT_INIT": "1001000000000000"
  92848. },
  92849. "attributes": {
  92850. "module_not_derived": "00000000000000000000000000000001",
  92851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92852. },
  92853. "port_directions": {
  92854. "I0": "input",
  92855. "I1": "input",
  92856. "I2": "input",
  92857. "I3": "input",
  92858. "O": "output"
  92859. },
  92860. "connections": {
  92861. "I0": [ 1534 ],
  92862. "I1": [ 976 ],
  92863. "I2": [ 4271 ],
  92864. "I3": [ 4270 ],
  92865. "O": [ 4272 ]
  92866. }
  92867. },
  92868. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_1_O_SB_LUT4_O": {
  92869. "hide_name": 0,
  92870. "type": "SB_LUT4",
  92871. "parameters": {
  92872. "LUT_INIT": "1100010000110001"
  92873. },
  92874. "attributes": {
  92875. "module_not_derived": "00000000000000000000000000000001",
  92876. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92877. },
  92878. "port_directions": {
  92879. "I0": "input",
  92880. "I1": "input",
  92881. "I2": "input",
  92882. "I3": "input",
  92883. "O": "output"
  92884. },
  92885. "connections": {
  92886. "I0": [ 1532 ],
  92887. "I1": [ 1533 ],
  92888. "I2": [ 972 ],
  92889. "I3": [ 974 ],
  92890. "O": [ 4271 ]
  92891. }
  92892. },
  92893. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_O_SB_LUT4_O": {
  92894. "hide_name": 0,
  92895. "type": "SB_LUT4",
  92896. "parameters": {
  92897. "LUT_INIT": "1100111100000000"
  92898. },
  92899. "attributes": {
  92900. "module_not_derived": "00000000000000000000000000000001",
  92901. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  92902. },
  92903. "port_directions": {
  92904. "I0": "input",
  92905. "I1": "input",
  92906. "I2": "input",
  92907. "I3": "input",
  92908. "O": "output"
  92909. },
  92910. "connections": {
  92911. "I0": [ "0" ],
  92912. "I1": [ 1549 ],
  92913. "I2": [ 970 ],
  92914. "I3": [ 4273 ],
  92915. "O": [ 4274 ]
  92916. }
  92917. },
  92918. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_O_SB_LUT4_O_1": {
  92919. "hide_name": 0,
  92920. "type": "SB_LUT4",
  92921. "parameters": {
  92922. "LUT_INIT": "1000010000100001"
  92923. },
  92924. "attributes": {
  92925. "module_not_derived": "00000000000000000000000000000001",
  92926. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92927. },
  92928. "port_directions": {
  92929. "I0": "input",
  92930. "I1": "input",
  92931. "I2": "input",
  92932. "I3": "input",
  92933. "O": "output"
  92934. },
  92935. "connections": {
  92936. "I0": [ 1550 ],
  92937. "I1": [ 1530 ],
  92938. "I2": [ 972 ],
  92939. "I3": [ 978 ],
  92940. "O": [ 4275 ]
  92941. }
  92942. },
  92943. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_O_SB_LUT4_O_2": {
  92944. "hide_name": 0,
  92945. "type": "SB_LUT4",
  92946. "parameters": {
  92947. "LUT_INIT": "1111010100110001"
  92948. },
  92949. "attributes": {
  92950. "module_not_derived": "00000000000000000000000000000001",
  92951. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92952. },
  92953. "port_directions": {
  92954. "I0": "input",
  92955. "I1": "input",
  92956. "I2": "input",
  92957. "I3": "input",
  92958. "O": "output"
  92959. },
  92960. "connections": {
  92961. "I0": [ 1551 ],
  92962. "I1": [ 1552 ],
  92963. "I2": [ 974 ],
  92964. "I3": [ 976 ],
  92965. "O": [ 4276 ]
  92966. }
  92967. },
  92968. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  92969. "hide_name": 0,
  92970. "type": "SB_LUT4",
  92971. "parameters": {
  92972. "LUT_INIT": "1000110010101111"
  92973. },
  92974. "attributes": {
  92975. "module_not_derived": "00000000000000000000000000000001",
  92976. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  92977. },
  92978. "port_directions": {
  92979. "I0": "input",
  92980. "I1": "input",
  92981. "I2": "input",
  92982. "I3": "input",
  92983. "O": "output"
  92984. },
  92985. "connections": {
  92986. "I0": [ 1551 ],
  92987. "I1": [ 1552 ],
  92988. "I2": [ 974 ],
  92989. "I3": [ 976 ],
  92990. "O": [ 4273 ]
  92991. }
  92992. },
  92993. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q": {
  92994. "hide_name": 0,
  92995. "type": "SB_DFFE",
  92996. "parameters": {
  92997. },
  92998. "attributes": {
  92999. "module_not_derived": "00000000000000000000000000000001",
  93000. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93001. },
  93002. "port_directions": {
  93003. "C": "input",
  93004. "D": "input",
  93005. "E": "input",
  93006. "Q": "output"
  93007. },
  93008. "connections": {
  93009. "C": [ 42 ],
  93010. "D": [ 3832 ],
  93011. "E": [ 2263 ],
  93012. "Q": [ 2843 ]
  93013. }
  93014. },
  93015. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_1": {
  93016. "hide_name": 0,
  93017. "type": "SB_DFFE",
  93018. "parameters": {
  93019. },
  93020. "attributes": {
  93021. "module_not_derived": "00000000000000000000000000000001",
  93022. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93023. },
  93024. "port_directions": {
  93025. "C": "input",
  93026. "D": "input",
  93027. "E": "input",
  93028. "Q": "output"
  93029. },
  93030. "connections": {
  93031. "C": [ 42 ],
  93032. "D": [ 3837 ],
  93033. "E": [ 2263 ],
  93034. "Q": [ 2771 ]
  93035. }
  93036. },
  93037. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_10": {
  93038. "hide_name": 0,
  93039. "type": "SB_DFFE",
  93040. "parameters": {
  93041. },
  93042. "attributes": {
  93043. "module_not_derived": "00000000000000000000000000000001",
  93044. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93045. },
  93046. "port_directions": {
  93047. "C": "input",
  93048. "D": "input",
  93049. "E": "input",
  93050. "Q": "output"
  93051. },
  93052. "connections": {
  93053. "C": [ 42 ],
  93054. "D": [ 3748 ],
  93055. "E": [ 2263 ],
  93056. "Q": [ 4038 ]
  93057. }
  93058. },
  93059. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_11": {
  93060. "hide_name": 0,
  93061. "type": "SB_DFFE",
  93062. "parameters": {
  93063. },
  93064. "attributes": {
  93065. "module_not_derived": "00000000000000000000000000000001",
  93066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93067. },
  93068. "port_directions": {
  93069. "C": "input",
  93070. "D": "input",
  93071. "E": "input",
  93072. "Q": "output"
  93073. },
  93074. "connections": {
  93075. "C": [ 42 ],
  93076. "D": [ 3756 ],
  93077. "E": [ 2263 ],
  93078. "Q": [ 2851 ]
  93079. }
  93080. },
  93081. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_12": {
  93082. "hide_name": 0,
  93083. "type": "SB_DFFE",
  93084. "parameters": {
  93085. },
  93086. "attributes": {
  93087. "module_not_derived": "00000000000000000000000000000001",
  93088. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93089. },
  93090. "port_directions": {
  93091. "C": "input",
  93092. "D": "input",
  93093. "E": "input",
  93094. "Q": "output"
  93095. },
  93096. "connections": {
  93097. "C": [ 42 ],
  93098. "D": [ 3766 ],
  93099. "E": [ 2263 ],
  93100. "Q": [ 4054 ]
  93101. }
  93102. },
  93103. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_13": {
  93104. "hide_name": 0,
  93105. "type": "SB_DFFE",
  93106. "parameters": {
  93107. },
  93108. "attributes": {
  93109. "module_not_derived": "00000000000000000000000000000001",
  93110. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93111. },
  93112. "port_directions": {
  93113. "C": "input",
  93114. "D": "input",
  93115. "E": "input",
  93116. "Q": "output"
  93117. },
  93118. "connections": {
  93119. "C": [ 42 ],
  93120. "D": [ 3771 ],
  93121. "E": [ 2263 ],
  93122. "Q": [ 4059 ]
  93123. }
  93124. },
  93125. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_14": {
  93126. "hide_name": 0,
  93127. "type": "SB_DFFE",
  93128. "parameters": {
  93129. },
  93130. "attributes": {
  93131. "module_not_derived": "00000000000000000000000000000001",
  93132. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93133. },
  93134. "port_directions": {
  93135. "C": "input",
  93136. "D": "input",
  93137. "E": "input",
  93138. "Q": "output"
  93139. },
  93140. "connections": {
  93141. "C": [ 42 ],
  93142. "D": [ 3774 ],
  93143. "E": [ 2263 ],
  93144. "Q": [ 4064 ]
  93145. }
  93146. },
  93147. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_15": {
  93148. "hide_name": 0,
  93149. "type": "SB_DFFE",
  93150. "parameters": {
  93151. },
  93152. "attributes": {
  93153. "module_not_derived": "00000000000000000000000000000001",
  93154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93155. },
  93156. "port_directions": {
  93157. "C": "input",
  93158. "D": "input",
  93159. "E": "input",
  93160. "Q": "output"
  93161. },
  93162. "connections": {
  93163. "C": [ 42 ],
  93164. "D": [ 3777 ],
  93165. "E": [ 2263 ],
  93166. "Q": [ 4069 ]
  93167. }
  93168. },
  93169. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_16": {
  93170. "hide_name": 0,
  93171. "type": "SB_DFFE",
  93172. "parameters": {
  93173. },
  93174. "attributes": {
  93175. "module_not_derived": "00000000000000000000000000000001",
  93176. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93177. },
  93178. "port_directions": {
  93179. "C": "input",
  93180. "D": "input",
  93181. "E": "input",
  93182. "Q": "output"
  93183. },
  93184. "connections": {
  93185. "C": [ 42 ],
  93186. "D": [ 3782 ],
  93187. "E": [ 2263 ],
  93188. "Q": [ 4074 ]
  93189. }
  93190. },
  93191. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_17": {
  93192. "hide_name": 0,
  93193. "type": "SB_DFFE",
  93194. "parameters": {
  93195. },
  93196. "attributes": {
  93197. "module_not_derived": "00000000000000000000000000000001",
  93198. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93199. },
  93200. "port_directions": {
  93201. "C": "input",
  93202. "D": "input",
  93203. "E": "input",
  93204. "Q": "output"
  93205. },
  93206. "connections": {
  93207. "C": [ 42 ],
  93208. "D": [ 3785 ],
  93209. "E": [ 2263 ],
  93210. "Q": [ 4079 ]
  93211. }
  93212. },
  93213. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_18": {
  93214. "hide_name": 0,
  93215. "type": "SB_DFFE",
  93216. "parameters": {
  93217. },
  93218. "attributes": {
  93219. "module_not_derived": "00000000000000000000000000000001",
  93220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93221. },
  93222. "port_directions": {
  93223. "C": "input",
  93224. "D": "input",
  93225. "E": "input",
  93226. "Q": "output"
  93227. },
  93228. "connections": {
  93229. "C": [ 42 ],
  93230. "D": [ 3790 ],
  93231. "E": [ 2263 ],
  93232. "Q": [ 4084 ]
  93233. }
  93234. },
  93235. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_19": {
  93236. "hide_name": 0,
  93237. "type": "SB_DFFE",
  93238. "parameters": {
  93239. },
  93240. "attributes": {
  93241. "module_not_derived": "00000000000000000000000000000001",
  93242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93243. },
  93244. "port_directions": {
  93245. "C": "input",
  93246. "D": "input",
  93247. "E": "input",
  93248. "Q": "output"
  93249. },
  93250. "connections": {
  93251. "C": [ 42 ],
  93252. "D": [ 3795 ],
  93253. "E": [ 2263 ],
  93254. "Q": [ 4089 ]
  93255. }
  93256. },
  93257. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_2": {
  93258. "hide_name": 0,
  93259. "type": "SB_DFFE",
  93260. "parameters": {
  93261. },
  93262. "attributes": {
  93263. "module_not_derived": "00000000000000000000000000000001",
  93264. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93265. },
  93266. "port_directions": {
  93267. "C": "input",
  93268. "D": "input",
  93269. "E": "input",
  93270. "Q": "output"
  93271. },
  93272. "connections": {
  93273. "C": [ 42 ],
  93274. "D": [ 3720 ],
  93275. "E": [ 2263 ],
  93276. "Q": [ 2756 ]
  93277. }
  93278. },
  93279. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_20": {
  93280. "hide_name": 0,
  93281. "type": "SB_DFFE",
  93282. "parameters": {
  93283. },
  93284. "attributes": {
  93285. "module_not_derived": "00000000000000000000000000000001",
  93286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93287. },
  93288. "port_directions": {
  93289. "C": "input",
  93290. "D": "input",
  93291. "E": "input",
  93292. "Q": "output"
  93293. },
  93294. "connections": {
  93295. "C": [ 42 ],
  93296. "D": [ 3801 ],
  93297. "E": [ 2263 ],
  93298. "Q": [ 2852 ]
  93299. }
  93300. },
  93301. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_21": {
  93302. "hide_name": 0,
  93303. "type": "SB_DFFE",
  93304. "parameters": {
  93305. },
  93306. "attributes": {
  93307. "module_not_derived": "00000000000000000000000000000001",
  93308. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93309. },
  93310. "port_directions": {
  93311. "C": "input",
  93312. "D": "input",
  93313. "E": "input",
  93314. "Q": "output"
  93315. },
  93316. "connections": {
  93317. "C": [ 42 ],
  93318. "D": [ 3806 ],
  93319. "E": [ 2263 ],
  93320. "Q": [ 4098 ]
  93321. }
  93322. },
  93323. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_22": {
  93324. "hide_name": 0,
  93325. "type": "SB_DFFE",
  93326. "parameters": {
  93327. },
  93328. "attributes": {
  93329. "module_not_derived": "00000000000000000000000000000001",
  93330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93331. },
  93332. "port_directions": {
  93333. "C": "input",
  93334. "D": "input",
  93335. "E": "input",
  93336. "Q": "output"
  93337. },
  93338. "connections": {
  93339. "C": [ 42 ],
  93340. "D": [ 3712 ],
  93341. "E": [ 2263 ],
  93342. "Q": [ 4047 ]
  93343. }
  93344. },
  93345. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_23": {
  93346. "hide_name": 0,
  93347. "type": "SB_DFFE",
  93348. "parameters": {
  93349. },
  93350. "attributes": {
  93351. "module_not_derived": "00000000000000000000000000000001",
  93352. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93353. },
  93354. "port_directions": {
  93355. "C": "input",
  93356. "D": "input",
  93357. "E": "input",
  93358. "Q": "output"
  93359. },
  93360. "connections": {
  93361. "C": [ 42 ],
  93362. "D": [ 3754 ],
  93363. "E": [ 2263 ],
  93364. "Q": [ 4099 ]
  93365. }
  93366. },
  93367. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_24": {
  93368. "hide_name": 0,
  93369. "type": "SB_DFFE",
  93370. "parameters": {
  93371. },
  93372. "attributes": {
  93373. "module_not_derived": "00000000000000000000000000000001",
  93374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93375. },
  93376. "port_directions": {
  93377. "C": "input",
  93378. "D": "input",
  93379. "E": "input",
  93380. "Q": "output"
  93381. },
  93382. "connections": {
  93383. "C": [ 42 ],
  93384. "D": [ 3799 ],
  93385. "E": [ 2263 ],
  93386. "Q": [ 2846 ]
  93387. }
  93388. },
  93389. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_25": {
  93390. "hide_name": 0,
  93391. "type": "SB_DFFE",
  93392. "parameters": {
  93393. },
  93394. "attributes": {
  93395. "module_not_derived": "00000000000000000000000000000001",
  93396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93397. },
  93398. "port_directions": {
  93399. "C": "input",
  93400. "D": "input",
  93401. "E": "input",
  93402. "Q": "output"
  93403. },
  93404. "connections": {
  93405. "C": [ 42 ],
  93406. "D": [ 3812 ],
  93407. "E": [ 2263 ],
  93408. "Q": [ 4110 ]
  93409. }
  93410. },
  93411. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_26": {
  93412. "hide_name": 0,
  93413. "type": "SB_DFFE",
  93414. "parameters": {
  93415. },
  93416. "attributes": {
  93417. "module_not_derived": "00000000000000000000000000000001",
  93418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93419. },
  93420. "port_directions": {
  93421. "C": "input",
  93422. "D": "input",
  93423. "E": "input",
  93424. "Q": "output"
  93425. },
  93426. "connections": {
  93427. "C": [ 42 ],
  93428. "D": [ 3817 ],
  93429. "E": [ 2263 ],
  93430. "Q": [ 4115 ]
  93431. }
  93432. },
  93433. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_27": {
  93434. "hide_name": 0,
  93435. "type": "SB_DFFE",
  93436. "parameters": {
  93437. },
  93438. "attributes": {
  93439. "module_not_derived": "00000000000000000000000000000001",
  93440. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93441. },
  93442. "port_directions": {
  93443. "C": "input",
  93444. "D": "input",
  93445. "E": "input",
  93446. "Q": "output"
  93447. },
  93448. "connections": {
  93449. "C": [ 42 ],
  93450. "D": [ 3822 ],
  93451. "E": [ 2263 ],
  93452. "Q": [ 4120 ]
  93453. }
  93454. },
  93455. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_28": {
  93456. "hide_name": 0,
  93457. "type": "SB_DFFE",
  93458. "parameters": {
  93459. },
  93460. "attributes": {
  93461. "module_not_derived": "00000000000000000000000000000001",
  93462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93463. },
  93464. "port_directions": {
  93465. "C": "input",
  93466. "D": "input",
  93467. "E": "input",
  93468. "Q": "output"
  93469. },
  93470. "connections": {
  93471. "C": [ 42 ],
  93472. "D": [ 3827 ],
  93473. "E": [ 2263 ],
  93474. "Q": [ 2848 ]
  93475. }
  93476. },
  93477. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_29": {
  93478. "hide_name": 0,
  93479. "type": "SB_DFFE",
  93480. "parameters": {
  93481. },
  93482. "attributes": {
  93483. "module_not_derived": "00000000000000000000000000000001",
  93484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93485. },
  93486. "port_directions": {
  93487. "C": "input",
  93488. "D": "input",
  93489. "E": "input",
  93490. "Q": "output"
  93491. },
  93492. "connections": {
  93493. "C": [ 42 ],
  93494. "D": [ 3714 ],
  93495. "E": [ 2263 ],
  93496. "Q": [ 2759 ]
  93497. }
  93498. },
  93499. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_3": {
  93500. "hide_name": 0,
  93501. "type": "SB_DFFE",
  93502. "parameters": {
  93503. },
  93504. "attributes": {
  93505. "module_not_derived": "00000000000000000000000000000001",
  93506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93507. },
  93508. "port_directions": {
  93509. "C": "input",
  93510. "D": "input",
  93511. "E": "input",
  93512. "Q": "output"
  93513. },
  93514. "connections": {
  93515. "C": [ 42 ],
  93516. "D": [ 3723 ],
  93517. "E": [ 2263 ],
  93518. "Q": [ 2849 ]
  93519. }
  93520. },
  93521. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_30": {
  93522. "hide_name": 0,
  93523. "type": "SB_DFFE",
  93524. "parameters": {
  93525. },
  93526. "attributes": {
  93527. "module_not_derived": "00000000000000000000000000000001",
  93528. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93529. },
  93530. "port_directions": {
  93531. "C": "input",
  93532. "D": "input",
  93533. "E": "input",
  93534. "Q": "output"
  93535. },
  93536. "connections": {
  93537. "C": [ 42 ],
  93538. "D": [ 3761 ],
  93539. "E": [ 2263 ],
  93540. "Q": [ 2770 ]
  93541. }
  93542. },
  93543. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_31": {
  93544. "hide_name": 0,
  93545. "type": "SB_DFFE",
  93546. "parameters": {
  93547. },
  93548. "attributes": {
  93549. "module_not_derived": "00000000000000000000000000000001",
  93550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93551. },
  93552. "port_directions": {
  93553. "C": "input",
  93554. "D": "input",
  93555. "E": "input",
  93556. "Q": "output"
  93557. },
  93558. "connections": {
  93559. "C": [ 42 ],
  93560. "D": [ 3710 ],
  93561. "E": [ 2263 ],
  93562. "Q": [ 2842 ]
  93563. }
  93564. },
  93565. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_4": {
  93566. "hide_name": 0,
  93567. "type": "SB_DFFE",
  93568. "parameters": {
  93569. },
  93570. "attributes": {
  93571. "module_not_derived": "00000000000000000000000000000001",
  93572. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93573. },
  93574. "port_directions": {
  93575. "C": "input",
  93576. "D": "input",
  93577. "E": "input",
  93578. "Q": "output"
  93579. },
  93580. "connections": {
  93581. "C": [ 42 ],
  93582. "D": [ 3726 ],
  93583. "E": [ 2263 ],
  93584. "Q": [ 4009 ]
  93585. }
  93586. },
  93587. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_5": {
  93588. "hide_name": 0,
  93589. "type": "SB_DFFE",
  93590. "parameters": {
  93591. },
  93592. "attributes": {
  93593. "module_not_derived": "00000000000000000000000000000001",
  93594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93595. },
  93596. "port_directions": {
  93597. "C": "input",
  93598. "D": "input",
  93599. "E": "input",
  93600. "Q": "output"
  93601. },
  93602. "connections": {
  93603. "C": [ 42 ],
  93604. "D": [ 3729 ],
  93605. "E": [ 2263 ],
  93606. "Q": [ 4014 ]
  93607. }
  93608. },
  93609. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_6": {
  93610. "hide_name": 0,
  93611. "type": "SB_DFFE",
  93612. "parameters": {
  93613. },
  93614. "attributes": {
  93615. "module_not_derived": "00000000000000000000000000000001",
  93616. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93617. },
  93618. "port_directions": {
  93619. "C": "input",
  93620. "D": "input",
  93621. "E": "input",
  93622. "Q": "output"
  93623. },
  93624. "connections": {
  93625. "C": [ 42 ],
  93626. "D": [ 3732 ],
  93627. "E": [ 2263 ],
  93628. "Q": [ 4019 ]
  93629. }
  93630. },
  93631. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_7": {
  93632. "hide_name": 0,
  93633. "type": "SB_DFFE",
  93634. "parameters": {
  93635. },
  93636. "attributes": {
  93637. "module_not_derived": "00000000000000000000000000000001",
  93638. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93639. },
  93640. "port_directions": {
  93641. "C": "input",
  93642. "D": "input",
  93643. "E": "input",
  93644. "Q": "output"
  93645. },
  93646. "connections": {
  93647. "C": [ 42 ],
  93648. "D": [ 3735 ],
  93649. "E": [ 2263 ],
  93650. "Q": [ 2845 ]
  93651. }
  93652. },
  93653. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_8": {
  93654. "hide_name": 0,
  93655. "type": "SB_DFFE",
  93656. "parameters": {
  93657. },
  93658. "attributes": {
  93659. "module_not_derived": "00000000000000000000000000000001",
  93660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93661. },
  93662. "port_directions": {
  93663. "C": "input",
  93664. "D": "input",
  93665. "E": "input",
  93666. "Q": "output"
  93667. },
  93668. "connections": {
  93669. "C": [ 42 ],
  93670. "D": [ 3738 ],
  93671. "E": [ 2263 ],
  93672. "Q": [ 4028 ]
  93673. }
  93674. },
  93675. "cpu_I.decode_to_execute_RS1_SB_DFFE_Q_9": {
  93676. "hide_name": 0,
  93677. "type": "SB_DFFE",
  93678. "parameters": {
  93679. },
  93680. "attributes": {
  93681. "module_not_derived": "00000000000000000000000000000001",
  93682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93683. },
  93684. "port_directions": {
  93685. "C": "input",
  93686. "D": "input",
  93687. "E": "input",
  93688. "Q": "output"
  93689. },
  93690. "connections": {
  93691. "C": [ 42 ],
  93692. "D": [ 3743 ],
  93693. "E": [ 2263 ],
  93694. "Q": [ 4033 ]
  93695. }
  93696. },
  93697. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q": {
  93698. "hide_name": 0,
  93699. "type": "SB_DFFE",
  93700. "parameters": {
  93701. },
  93702. "attributes": {
  93703. "module_not_derived": "00000000000000000000000000000001",
  93704. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93705. },
  93706. "port_directions": {
  93707. "C": "input",
  93708. "D": "input",
  93709. "E": "input",
  93710. "Q": "output"
  93711. },
  93712. "connections": {
  93713. "C": [ 42 ],
  93714. "D": [ 3956 ],
  93715. "E": [ 2263 ],
  93716. "Q": [ 3661 ]
  93717. }
  93718. },
  93719. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_1": {
  93720. "hide_name": 0,
  93721. "type": "SB_DFFE",
  93722. "parameters": {
  93723. },
  93724. "attributes": {
  93725. "module_not_derived": "00000000000000000000000000000001",
  93726. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93727. },
  93728. "port_directions": {
  93729. "C": "input",
  93730. "D": "input",
  93731. "E": "input",
  93732. "Q": "output"
  93733. },
  93734. "connections": {
  93735. "C": [ 42 ],
  93736. "D": [ 3959 ],
  93737. "E": [ 2263 ],
  93738. "Q": [ 3658 ]
  93739. }
  93740. },
  93741. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_10": {
  93742. "hide_name": 0,
  93743. "type": "SB_DFFE",
  93744. "parameters": {
  93745. },
  93746. "attributes": {
  93747. "module_not_derived": "00000000000000000000000000000001",
  93748. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93749. },
  93750. "port_directions": {
  93751. "C": "input",
  93752. "D": "input",
  93753. "E": "input",
  93754. "Q": "output"
  93755. },
  93756. "connections": {
  93757. "C": [ 42 ],
  93758. "D": [ 3884 ],
  93759. "E": [ 2263 ],
  93760. "Q": [ 3668 ]
  93761. }
  93762. },
  93763. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_11": {
  93764. "hide_name": 0,
  93765. "type": "SB_DFFE",
  93766. "parameters": {
  93767. },
  93768. "attributes": {
  93769. "module_not_derived": "00000000000000000000000000000001",
  93770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93771. },
  93772. "port_directions": {
  93773. "C": "input",
  93774. "D": "input",
  93775. "E": "input",
  93776. "Q": "output"
  93777. },
  93778. "connections": {
  93779. "C": [ 42 ],
  93780. "D": [ 3892 ],
  93781. "E": [ 2263 ],
  93782. "Q": [ 2934 ]
  93783. }
  93784. },
  93785. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_12": {
  93786. "hide_name": 0,
  93787. "type": "SB_DFFE",
  93788. "parameters": {
  93789. },
  93790. "attributes": {
  93791. "module_not_derived": "00000000000000000000000000000001",
  93792. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93793. },
  93794. "port_directions": {
  93795. "C": "input",
  93796. "D": "input",
  93797. "E": "input",
  93798. "Q": "output"
  93799. },
  93800. "connections": {
  93801. "C": [ 42 ],
  93802. "D": [ 3898 ],
  93803. "E": [ 2263 ],
  93804. "Q": [ 3672 ]
  93805. }
  93806. },
  93807. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_13": {
  93808. "hide_name": 0,
  93809. "type": "SB_DFFE",
  93810. "parameters": {
  93811. },
  93812. "attributes": {
  93813. "module_not_derived": "00000000000000000000000000000001",
  93814. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93815. },
  93816. "port_directions": {
  93817. "C": "input",
  93818. "D": "input",
  93819. "E": "input",
  93820. "Q": "output"
  93821. },
  93822. "connections": {
  93823. "C": [ 42 ],
  93824. "D": [ 3901 ],
  93825. "E": [ 2263 ],
  93826. "Q": [ 3674 ]
  93827. }
  93828. },
  93829. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_14": {
  93830. "hide_name": 0,
  93831. "type": "SB_DFFE",
  93832. "parameters": {
  93833. },
  93834. "attributes": {
  93835. "module_not_derived": "00000000000000000000000000000001",
  93836. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93837. },
  93838. "port_directions": {
  93839. "C": "input",
  93840. "D": "input",
  93841. "E": "input",
  93842. "Q": "output"
  93843. },
  93844. "connections": {
  93845. "C": [ 42 ],
  93846. "D": [ 3906 ],
  93847. "E": [ 2263 ],
  93848. "Q": [ 3676 ]
  93849. }
  93850. },
  93851. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_15": {
  93852. "hide_name": 0,
  93853. "type": "SB_DFFE",
  93854. "parameters": {
  93855. },
  93856. "attributes": {
  93857. "module_not_derived": "00000000000000000000000000000001",
  93858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93859. },
  93860. "port_directions": {
  93861. "C": "input",
  93862. "D": "input",
  93863. "E": "input",
  93864. "Q": "output"
  93865. },
  93866. "connections": {
  93867. "C": [ 42 ],
  93868. "D": [ 3911 ],
  93869. "E": [ 2263 ],
  93870. "Q": [ 2913 ]
  93871. }
  93872. },
  93873. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_16": {
  93874. "hide_name": 0,
  93875. "type": "SB_DFFE",
  93876. "parameters": {
  93877. },
  93878. "attributes": {
  93879. "module_not_derived": "00000000000000000000000000000001",
  93880. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93881. },
  93882. "port_directions": {
  93883. "C": "input",
  93884. "D": "input",
  93885. "E": "input",
  93886. "Q": "output"
  93887. },
  93888. "connections": {
  93889. "C": [ 42 ],
  93890. "D": [ 3914 ],
  93891. "E": [ 2263 ],
  93892. "Q": [ 3664 ]
  93893. }
  93894. },
  93895. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_17": {
  93896. "hide_name": 0,
  93897. "type": "SB_DFFE",
  93898. "parameters": {
  93899. },
  93900. "attributes": {
  93901. "module_not_derived": "00000000000000000000000000000001",
  93902. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93903. },
  93904. "port_directions": {
  93905. "C": "input",
  93906. "D": "input",
  93907. "E": "input",
  93908. "Q": "output"
  93909. },
  93910. "connections": {
  93911. "C": [ 42 ],
  93912. "D": [ 3919 ],
  93913. "E": [ 2263 ],
  93914. "Q": [ 2898 ]
  93915. }
  93916. },
  93917. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_18": {
  93918. "hide_name": 0,
  93919. "type": "SB_DFFE",
  93920. "parameters": {
  93921. },
  93922. "attributes": {
  93923. "module_not_derived": "00000000000000000000000000000001",
  93924. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93925. },
  93926. "port_directions": {
  93927. "C": "input",
  93928. "D": "input",
  93929. "E": "input",
  93930. "Q": "output"
  93931. },
  93932. "connections": {
  93933. "C": [ 42 ],
  93934. "D": [ 3922 ],
  93935. "E": [ 2263 ],
  93936. "Q": [ 3657 ]
  93937. }
  93938. },
  93939. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_19": {
  93940. "hide_name": 0,
  93941. "type": "SB_DFFE",
  93942. "parameters": {
  93943. },
  93944. "attributes": {
  93945. "module_not_derived": "00000000000000000000000000000001",
  93946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93947. },
  93948. "port_directions": {
  93949. "C": "input",
  93950. "D": "input",
  93951. "E": "input",
  93952. "Q": "output"
  93953. },
  93954. "connections": {
  93955. "C": [ 42 ],
  93956. "D": [ 3925 ],
  93957. "E": [ 2263 ],
  93958. "Q": [ 2882 ]
  93959. }
  93960. },
  93961. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_2": {
  93962. "hide_name": 0,
  93963. "type": "SB_DFFE",
  93964. "parameters": {
  93965. },
  93966. "attributes": {
  93967. "module_not_derived": "00000000000000000000000000000001",
  93968. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93969. },
  93970. "port_directions": {
  93971. "C": "input",
  93972. "D": "input",
  93973. "E": "input",
  93974. "Q": "output"
  93975. },
  93976. "connections": {
  93977. "C": [ 42 ],
  93978. "D": [ 3851 ],
  93979. "E": [ 2263 ],
  93980. "Q": [ 3654 ]
  93981. }
  93982. },
  93983. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_20": {
  93984. "hide_name": 0,
  93985. "type": "SB_DFFE",
  93986. "parameters": {
  93987. },
  93988. "attributes": {
  93989. "module_not_derived": "00000000000000000000000000000001",
  93990. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  93991. },
  93992. "port_directions": {
  93993. "C": "input",
  93994. "D": "input",
  93995. "E": "input",
  93996. "Q": "output"
  93997. },
  93998. "connections": {
  93999. "C": [ 42 ],
  94000. "D": [ 3935 ],
  94001. "E": [ 2263 ],
  94002. "Q": [ 2870 ]
  94003. }
  94004. },
  94005. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_21": {
  94006. "hide_name": 0,
  94007. "type": "SB_DFFE",
  94008. "parameters": {
  94009. },
  94010. "attributes": {
  94011. "module_not_derived": "00000000000000000000000000000001",
  94012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94013. },
  94014. "port_directions": {
  94015. "C": "input",
  94016. "D": "input",
  94017. "E": "input",
  94018. "Q": "output"
  94019. },
  94020. "connections": {
  94021. "C": [ 42 ],
  94022. "D": [ 3938 ],
  94023. "E": [ 2263 ],
  94024. "Q": [ 3076 ]
  94025. }
  94026. },
  94027. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_22": {
  94028. "hide_name": 0,
  94029. "type": "SB_DFFE",
  94030. "parameters": {
  94031. },
  94032. "attributes": {
  94033. "module_not_derived": "00000000000000000000000000000001",
  94034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94035. },
  94036. "port_directions": {
  94037. "C": "input",
  94038. "D": "input",
  94039. "E": "input",
  94040. "Q": "output"
  94041. },
  94042. "connections": {
  94043. "C": [ 42 ],
  94044. "D": [ 3845 ],
  94045. "E": [ 2263 ],
  94046. "Q": [ 3641 ]
  94047. }
  94048. },
  94049. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_23": {
  94050. "hide_name": 0,
  94051. "type": "SB_DFFE",
  94052. "parameters": {
  94053. },
  94054. "attributes": {
  94055. "module_not_derived": "00000000000000000000000000000001",
  94056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94057. },
  94058. "port_directions": {
  94059. "C": "input",
  94060. "D": "input",
  94061. "E": "input",
  94062. "Q": "output"
  94063. },
  94064. "connections": {
  94065. "C": [ 42 ],
  94066. "D": [ 3890 ],
  94067. "E": [ 2263 ],
  94068. "Q": [ 3061 ]
  94069. }
  94070. },
  94071. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_24": {
  94072. "hide_name": 0,
  94073. "type": "SB_DFFE",
  94074. "parameters": {
  94075. },
  94076. "attributes": {
  94077. "module_not_derived": "00000000000000000000000000000001",
  94078. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94079. },
  94080. "port_directions": {
  94081. "C": "input",
  94082. "D": "input",
  94083. "E": "input",
  94084. "Q": "output"
  94085. },
  94086. "connections": {
  94087. "C": [ 42 ],
  94088. "D": [ 3933 ],
  94089. "E": [ 2263 ],
  94090. "Q": [ 3047 ]
  94091. }
  94092. },
  94093. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_25": {
  94094. "hide_name": 0,
  94095. "type": "SB_DFFE",
  94096. "parameters": {
  94097. },
  94098. "attributes": {
  94099. "module_not_derived": "00000000000000000000000000000001",
  94100. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94101. },
  94102. "port_directions": {
  94103. "C": "input",
  94104. "D": "input",
  94105. "E": "input",
  94106. "Q": "output"
  94107. },
  94108. "connections": {
  94109. "C": [ 42 ],
  94110. "D": [ 3944 ],
  94111. "E": [ 2263 ],
  94112. "Q": [ 3036 ]
  94113. }
  94114. },
  94115. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_26": {
  94116. "hide_name": 0,
  94117. "type": "SB_DFFE",
  94118. "parameters": {
  94119. },
  94120. "attributes": {
  94121. "module_not_derived": "00000000000000000000000000000001",
  94122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94123. },
  94124. "port_directions": {
  94125. "C": "input",
  94126. "D": "input",
  94127. "E": "input",
  94128. "Q": "output"
  94129. },
  94130. "connections": {
  94131. "C": [ 42 ],
  94132. "D": [ 3947 ],
  94133. "E": [ 2263 ],
  94134. "Q": [ 3022 ]
  94135. }
  94136. },
  94137. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_27": {
  94138. "hide_name": 0,
  94139. "type": "SB_DFFE",
  94140. "parameters": {
  94141. },
  94142. "attributes": {
  94143. "module_not_derived": "00000000000000000000000000000001",
  94144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94145. },
  94146. "port_directions": {
  94147. "C": "input",
  94148. "D": "input",
  94149. "E": "input",
  94150. "Q": "output"
  94151. },
  94152. "connections": {
  94153. "C": [ 42 ],
  94154. "D": [ 3950 ],
  94155. "E": [ 2263 ],
  94156. "Q": [ 3653 ]
  94157. }
  94158. },
  94159. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_28": {
  94160. "hide_name": 0,
  94161. "type": "SB_DFFE",
  94162. "parameters": {
  94163. },
  94164. "attributes": {
  94165. "module_not_derived": "00000000000000000000000000000001",
  94166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94167. },
  94168. "port_directions": {
  94169. "C": "input",
  94170. "D": "input",
  94171. "E": "input",
  94172. "Q": "output"
  94173. },
  94174. "connections": {
  94175. "C": [ 42 ],
  94176. "D": [ 3953 ],
  94177. "E": [ 2263 ],
  94178. "Q": [ 3650 ]
  94179. }
  94180. },
  94181. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_29": {
  94182. "hide_name": 0,
  94183. "type": "SB_DFFE",
  94184. "parameters": {
  94185. },
  94186. "attributes": {
  94187. "module_not_derived": "00000000000000000000000000000001",
  94188. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94189. },
  94190. "port_directions": {
  94191. "C": "input",
  94192. "D": "input",
  94193. "E": "input",
  94194. "Q": "output"
  94195. },
  94196. "connections": {
  94197. "C": [ 42 ],
  94198. "D": [ 3847 ],
  94199. "E": [ 2263 ],
  94200. "Q": [ 3646 ]
  94201. }
  94202. },
  94203. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_3": {
  94204. "hide_name": 0,
  94205. "type": "SB_DFFE",
  94206. "parameters": {
  94207. },
  94208. "attributes": {
  94209. "module_not_derived": "00000000000000000000000000000001",
  94210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94211. },
  94212. "port_directions": {
  94213. "C": "input",
  94214. "D": "input",
  94215. "E": "input",
  94216. "Q": "output"
  94217. },
  94218. "connections": {
  94219. "C": [ 42 ],
  94220. "D": [ 3856 ],
  94221. "E": [ 2263 ],
  94222. "Q": [ 2996 ]
  94223. }
  94224. },
  94225. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_30": {
  94226. "hide_name": 0,
  94227. "type": "SB_DFFE",
  94228. "parameters": {
  94229. },
  94230. "attributes": {
  94231. "module_not_derived": "00000000000000000000000000000001",
  94232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94233. },
  94234. "port_directions": {
  94235. "C": "input",
  94236. "D": "input",
  94237. "E": "input",
  94238. "Q": "output"
  94239. },
  94240. "connections": {
  94241. "C": [ 42 ],
  94242. "D": [ 3895 ],
  94243. "E": [ 2263 ],
  94244. "Q": [ 2535 ]
  94245. }
  94246. },
  94247. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_31": {
  94248. "hide_name": 0,
  94249. "type": "SB_DFFE",
  94250. "parameters": {
  94251. },
  94252. "attributes": {
  94253. "module_not_derived": "00000000000000000000000000000001",
  94254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94255. },
  94256. "port_directions": {
  94257. "C": "input",
  94258. "D": "input",
  94259. "E": "input",
  94260. "Q": "output"
  94261. },
  94262. "connections": {
  94263. "C": [ 42 ],
  94264. "D": [ 3843 ],
  94265. "E": [ 2263 ],
  94266. "Q": [ 3639 ]
  94267. }
  94268. },
  94269. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_4": {
  94270. "hide_name": 0,
  94271. "type": "SB_DFFE",
  94272. "parameters": {
  94273. },
  94274. "attributes": {
  94275. "module_not_derived": "00000000000000000000000000000001",
  94276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94277. },
  94278. "port_directions": {
  94279. "C": "input",
  94280. "D": "input",
  94281. "E": "input",
  94282. "Q": "output"
  94283. },
  94284. "connections": {
  94285. "C": [ 42 ],
  94286. "D": [ 3861 ],
  94287. "E": [ 2263 ],
  94288. "Q": [ 3647 ]
  94289. }
  94290. },
  94291. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_5": {
  94292. "hide_name": 0,
  94293. "type": "SB_DFFE",
  94294. "parameters": {
  94295. },
  94296. "attributes": {
  94297. "module_not_derived": "00000000000000000000000000000001",
  94298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94299. },
  94300. "port_directions": {
  94301. "C": "input",
  94302. "D": "input",
  94303. "E": "input",
  94304. "Q": "output"
  94305. },
  94306. "connections": {
  94307. "C": [ 42 ],
  94308. "D": [ 3866 ],
  94309. "E": [ 2263 ],
  94310. "Q": [ 3643 ]
  94311. }
  94312. },
  94313. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_6": {
  94314. "hide_name": 0,
  94315. "type": "SB_DFFE",
  94316. "parameters": {
  94317. },
  94318. "attributes": {
  94319. "module_not_derived": "00000000000000000000000000000001",
  94320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94321. },
  94322. "port_directions": {
  94323. "C": "input",
  94324. "D": "input",
  94325. "E": "input",
  94326. "Q": "output"
  94327. },
  94328. "connections": {
  94329. "C": [ 42 ],
  94330. "D": [ 3868 ],
  94331. "E": [ 2263 ],
  94332. "Q": [ 3016 ]
  94333. }
  94334. },
  94335. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_7": {
  94336. "hide_name": 0,
  94337. "type": "SB_DFFE",
  94338. "parameters": {
  94339. },
  94340. "attributes": {
  94341. "module_not_derived": "00000000000000000000000000000001",
  94342. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94343. },
  94344. "port_directions": {
  94345. "C": "input",
  94346. "D": "input",
  94347. "E": "input",
  94348. "Q": "output"
  94349. },
  94350. "connections": {
  94351. "C": [ 42 ],
  94352. "D": [ 3873 ],
  94353. "E": [ 2263 ],
  94354. "Q": [ 3684 ]
  94355. }
  94356. },
  94357. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_8": {
  94358. "hide_name": 0,
  94359. "type": "SB_DFFE",
  94360. "parameters": {
  94361. },
  94362. "attributes": {
  94363. "module_not_derived": "00000000000000000000000000000001",
  94364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94365. },
  94366. "port_directions": {
  94367. "C": "input",
  94368. "D": "input",
  94369. "E": "input",
  94370. "Q": "output"
  94371. },
  94372. "connections": {
  94373. "C": [ 42 ],
  94374. "D": [ 3878 ],
  94375. "E": [ 2263 ],
  94376. "Q": [ 2954 ]
  94377. }
  94378. },
  94379. "cpu_I.decode_to_execute_RS2_SB_DFFE_Q_9": {
  94380. "hide_name": 0,
  94381. "type": "SB_DFFE",
  94382. "parameters": {
  94383. },
  94384. "attributes": {
  94385. "module_not_derived": "00000000000000000000000000000001",
  94386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94387. },
  94388. "port_directions": {
  94389. "C": "input",
  94390. "D": "input",
  94391. "E": "input",
  94392. "Q": "output"
  94393. },
  94394. "connections": {
  94395. "C": [ 42 ],
  94396. "D": [ 3881 ],
  94397. "E": [ 2263 ],
  94398. "Q": [ 3666 ]
  94399. }
  94400. },
  94401. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_DFFE_Q": {
  94402. "hide_name": 0,
  94403. "type": "SB_DFFE",
  94404. "parameters": {
  94405. },
  94406. "attributes": {
  94407. "module_not_derived": "00000000000000000000000000000001",
  94408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94409. },
  94410. "port_directions": {
  94411. "C": "input",
  94412. "D": "input",
  94413. "E": "input",
  94414. "Q": "output"
  94415. },
  94416. "connections": {
  94417. "C": [ 42 ],
  94418. "D": [ 3291 ],
  94419. "E": [ 2263 ],
  94420. "Q": [ 4277 ]
  94421. }
  94422. },
  94423. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_DFFE_Q_1": {
  94424. "hide_name": 0,
  94425. "type": "SB_DFFE",
  94426. "parameters": {
  94427. },
  94428. "attributes": {
  94429. "module_not_derived": "00000000000000000000000000000001",
  94430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94431. },
  94432. "port_directions": {
  94433. "C": "input",
  94434. "D": "input",
  94435. "E": "input",
  94436. "Q": "output"
  94437. },
  94438. "connections": {
  94439. "C": [ 42 ],
  94440. "D": [ 3294 ],
  94441. "E": [ 2263 ],
  94442. "Q": [ 4278 ]
  94443. }
  94444. },
  94445. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_LUT4_I1": {
  94446. "hide_name": 0,
  94447. "type": "SB_LUT4",
  94448. "parameters": {
  94449. "LUT_INIT": "0000000011000000"
  94450. },
  94451. "attributes": {
  94452. "module_not_derived": "00000000000000000000000000000001",
  94453. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  94454. },
  94455. "port_directions": {
  94456. "I0": "input",
  94457. "I1": "input",
  94458. "I2": "input",
  94459. "I3": "input",
  94460. "O": "output"
  94461. },
  94462. "connections": {
  94463. "I0": [ "0" ],
  94464. "I1": [ 4277 ],
  94465. "I2": [ 4278 ],
  94466. "I3": [ 2543 ],
  94467. "O": [ 2410 ]
  94468. }
  94469. },
  94470. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_LUT4_I2": {
  94471. "hide_name": 0,
  94472. "type": "SB_LUT4",
  94473. "parameters": {
  94474. "LUT_INIT": "0000111100000000"
  94475. },
  94476. "attributes": {
  94477. "module_not_derived": "00000000000000000000000000000001",
  94478. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  94479. },
  94480. "port_directions": {
  94481. "I0": "input",
  94482. "I1": "input",
  94483. "I2": "input",
  94484. "I3": "input",
  94485. "O": "output"
  94486. },
  94487. "connections": {
  94488. "I0": [ "0" ],
  94489. "I1": [ "0" ],
  94490. "I2": [ 4277 ],
  94491. "I3": [ 4278 ],
  94492. "O": [ 2378 ]
  94493. }
  94494. },
  94495. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_LUT4_I2_O_SB_LUT4_O": {
  94496. "hide_name": 0,
  94497. "type": "SB_LUT4",
  94498. "parameters": {
  94499. "LUT_INIT": "1010000000001100"
  94500. },
  94501. "attributes": {
  94502. "module_not_derived": "00000000000000000000000000000001",
  94503. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94504. },
  94505. "port_directions": {
  94506. "I0": "input",
  94507. "I1": "input",
  94508. "I2": "input",
  94509. "I3": "input",
  94510. "O": "output"
  94511. },
  94512. "connections": {
  94513. "I0": [ 952 ],
  94514. "I1": [ 4120 ],
  94515. "I2": [ 2757 ],
  94516. "I3": [ 2758 ],
  94517. "O": [ 2380 ]
  94518. }
  94519. },
  94520. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_LUT4_I2_O_SB_LUT4_O_1": {
  94521. "hide_name": 0,
  94522. "type": "SB_LUT4",
  94523. "parameters": {
  94524. "LUT_INIT": "0000101000001100"
  94525. },
  94526. "attributes": {
  94527. "module_not_derived": "00000000000000000000000000000001",
  94528. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94529. },
  94530. "port_directions": {
  94531. "I0": "input",
  94532. "I1": "input",
  94533. "I2": "input",
  94534. "I3": "input",
  94535. "O": "output"
  94536. },
  94537. "connections": {
  94538. "I0": [ 996 ],
  94539. "I1": [ 4009 ],
  94540. "I2": [ 2757 ],
  94541. "I3": [ 2758 ],
  94542. "O": [ 2379 ]
  94543. }
  94544. },
  94545. "cpu_I.decode_to_execute_SRC1_CTRL_SB_DFFE_Q": {
  94546. "hide_name": 0,
  94547. "type": "SB_DFFE",
  94548. "parameters": {
  94549. },
  94550. "attributes": {
  94551. "module_not_derived": "00000000000000000000000000000001",
  94552. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94553. },
  94554. "port_directions": {
  94555. "C": "input",
  94556. "D": "input",
  94557. "E": "input",
  94558. "Q": "output"
  94559. },
  94560. "connections": {
  94561. "C": [ 42 ],
  94562. "D": [ 2856 ],
  94563. "E": [ 2263 ],
  94564. "Q": [ 2757 ]
  94565. }
  94566. },
  94567. "cpu_I.decode_to_execute_SRC1_CTRL_SB_DFFE_Q_1": {
  94568. "hide_name": 0,
  94569. "type": "SB_DFFE",
  94570. "parameters": {
  94571. },
  94572. "attributes": {
  94573. "module_not_derived": "00000000000000000000000000000001",
  94574. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94575. },
  94576. "port_directions": {
  94577. "C": "input",
  94578. "D": "input",
  94579. "E": "input",
  94580. "Q": "output"
  94581. },
  94582. "connections": {
  94583. "C": [ 42 ],
  94584. "D": [ 2857 ],
  94585. "E": [ 2263 ],
  94586. "Q": [ 2758 ]
  94587. }
  94588. },
  94589. "cpu_I.decode_to_execute_SRC2_CTRL_SB_DFFE_Q": {
  94590. "hide_name": 0,
  94591. "type": "SB_DFFE",
  94592. "parameters": {
  94593. },
  94594. "attributes": {
  94595. "module_not_derived": "00000000000000000000000000000001",
  94596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94597. },
  94598. "port_directions": {
  94599. "C": "input",
  94600. "D": "input",
  94601. "E": "input",
  94602. "Q": "output"
  94603. },
  94604. "connections": {
  94605. "C": [ 42 ],
  94606. "D": [ 2330 ],
  94607. "E": [ 2263 ],
  94608. "Q": [ 2871 ]
  94609. }
  94610. },
  94611. "cpu_I.decode_to_execute_SRC2_CTRL_SB_DFFE_Q_1": {
  94612. "hide_name": 0,
  94613. "type": "SB_DFFE",
  94614. "parameters": {
  94615. },
  94616. "attributes": {
  94617. "module_not_derived": "00000000000000000000000000000001",
  94618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94619. },
  94620. "port_directions": {
  94621. "C": "input",
  94622. "D": "input",
  94623. "E": "input",
  94624. "Q": "output"
  94625. },
  94626. "connections": {
  94627. "C": [ 42 ],
  94628. "D": [ 2331 ],
  94629. "E": [ 2263 ],
  94630. "Q": [ 2872 ]
  94631. }
  94632. },
  94633. "cpu_I.decode_to_execute_SRC2_FORCE_ZERO_SB_DFFE_Q": {
  94634. "hide_name": 0,
  94635. "type": "SB_DFFE",
  94636. "parameters": {
  94637. },
  94638. "attributes": {
  94639. "module_not_derived": "00000000000000000000000000000001",
  94640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94641. },
  94642. "port_directions": {
  94643. "C": "input",
  94644. "D": "input",
  94645. "E": "input",
  94646. "Q": "output"
  94647. },
  94648. "connections": {
  94649. "C": [ 42 ],
  94650. "D": [ 3964 ],
  94651. "E": [ 2263 ],
  94652. "Q": [ 1254 ]
  94653. }
  94654. },
  94655. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_DFFE_Q": {
  94656. "hide_name": 0,
  94657. "type": "SB_DFFE",
  94658. "parameters": {
  94659. },
  94660. "attributes": {
  94661. "module_not_derived": "00000000000000000000000000000001",
  94662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94663. },
  94664. "port_directions": {
  94665. "C": "input",
  94666. "D": "input",
  94667. "E": "input",
  94668. "Q": "output"
  94669. },
  94670. "connections": {
  94671. "C": [ 42 ],
  94672. "D": [ 2340 ],
  94673. "E": [ 2263 ],
  94674. "Q": [ 4279 ]
  94675. }
  94676. },
  94677. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1": {
  94678. "hide_name": 0,
  94679. "type": "SB_LUT4",
  94680. "parameters": {
  94681. "LUT_INIT": "1100000000000011"
  94682. },
  94683. "attributes": {
  94684. "module_not_derived": "00000000000000000000000000000001",
  94685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  94686. },
  94687. "port_directions": {
  94688. "I0": "input",
  94689. "I1": "input",
  94690. "I2": "input",
  94691. "I3": "input",
  94692. "O": "output"
  94693. },
  94694. "connections": {
  94695. "I0": [ "0" ],
  94696. "I1": [ 4279 ],
  94697. "I2": [ 1251 ],
  94698. "I3": [ 1252 ],
  94699. "O": [ 2778 ]
  94700. }
  94701. },
  94702. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1_I3_SB_LUT4_O": {
  94703. "hide_name": 0,
  94704. "type": "SB_LUT4",
  94705. "parameters": {
  94706. "LUT_INIT": "0011111100000000"
  94707. },
  94708. "attributes": {
  94709. "module_not_derived": "00000000000000000000000000000001",
  94710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  94711. },
  94712. "port_directions": {
  94713. "I0": "input",
  94714. "I1": "input",
  94715. "I2": "input",
  94716. "I3": "input",
  94717. "O": "output"
  94718. },
  94719. "connections": {
  94720. "I0": [ "0" ],
  94721. "I1": [ 4249 ],
  94722. "I2": [ 2868 ],
  94723. "I3": [ 4280 ],
  94724. "O": [ 1252 ]
  94725. }
  94726. },
  94727. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  94728. "hide_name": 0,
  94729. "type": "SB_LUT4",
  94730. "parameters": {
  94731. "LUT_INIT": "1111001100110101"
  94732. },
  94733. "attributes": {
  94734. "module_not_derived": "00000000000000000000000000000001",
  94735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94736. },
  94737. "port_directions": {
  94738. "I0": "input",
  94739. "I1": "input",
  94740. "I2": "input",
  94741. "I3": "input",
  94742. "O": "output"
  94743. },
  94744. "connections": {
  94745. "I0": [ 3661 ],
  94746. "I1": [ 943 ],
  94747. "I2": [ 2871 ],
  94748. "I3": [ 2872 ],
  94749. "O": [ 4280 ]
  94750. }
  94751. },
  94752. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1_O_SB_LUT4_O": {
  94753. "hide_name": 0,
  94754. "type": "SB_LUT4",
  94755. "parameters": {
  94756. "LUT_INIT": "0000001000000111"
  94757. },
  94758. "attributes": {
  94759. "module_not_derived": "00000000000000000000000000000001",
  94760. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94761. },
  94762. "port_directions": {
  94763. "I0": "input",
  94764. "I1": "input",
  94765. "I2": "input",
  94766. "I3": "input",
  94767. "O": "output"
  94768. },
  94769. "connections": {
  94770. "I0": [ 1254 ],
  94771. "I1": [ 1251 ],
  94772. "I2": [ 4281 ],
  94773. "I3": [ 1255 ],
  94774. "O": [ 2779 ]
  94775. }
  94776. },
  94777. "cpu_I.decode_to_execute_SRC_USE_SUB_LESS_SB_DFFE_Q": {
  94778. "hide_name": 0,
  94779. "type": "SB_DFFE",
  94780. "parameters": {
  94781. },
  94782. "attributes": {
  94783. "module_not_derived": "00000000000000000000000000000001",
  94784. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  94785. },
  94786. "port_directions": {
  94787. "C": "input",
  94788. "D": "input",
  94789. "E": "input",
  94790. "Q": "output"
  94791. },
  94792. "connections": {
  94793. "C": [ 42 ],
  94794. "D": [ 3966 ],
  94795. "E": [ 2263 ],
  94796. "Q": [ 2991 ]
  94797. }
  94798. },
  94799. "cpu_I.execute_BRANCH_DO_SB_LUT4_O": {
  94800. "hide_name": 0,
  94801. "type": "SB_LUT4",
  94802. "parameters": {
  94803. "LUT_INIT": "0000111101001110"
  94804. },
  94805. "attributes": {
  94806. "module_not_derived": "00000000000000000000000000000001",
  94807. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94808. },
  94809. "port_directions": {
  94810. "I0": "input",
  94811. "I1": "input",
  94812. "I2": "input",
  94813. "I3": "input",
  94814. "O": "output"
  94815. },
  94816. "connections": {
  94817. "I0": [ 3967 ],
  94818. "I1": [ 4267 ],
  94819. "I2": [ 4282 ],
  94820. "I3": [ 4283 ],
  94821. "O": [ 4284 ]
  94822. }
  94823. },
  94824. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O": {
  94825. "hide_name": 0,
  94826. "type": "SB_LUT4",
  94827. "parameters": {
  94828. "LUT_INIT": "1001111100000000"
  94829. },
  94830. "attributes": {
  94831. "module_not_derived": "00000000000000000000000000000001",
  94832. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94833. },
  94834. "port_directions": {
  94835. "I0": "input",
  94836. "I1": "input",
  94837. "I2": "input",
  94838. "I3": "input",
  94839. "O": "output"
  94840. },
  94841. "connections": {
  94842. "I0": [ 948 ],
  94843. "I1": [ 2770 ],
  94844. "I2": [ 3969 ],
  94845. "I3": [ 4285 ],
  94846. "O": [ 4282 ]
  94847. }
  94848. },
  94849. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1": {
  94850. "hide_name": 0,
  94851. "type": "SB_LUT4",
  94852. "parameters": {
  94853. "LUT_INIT": "1100110011001000"
  94854. },
  94855. "attributes": {
  94856. "module_not_derived": "00000000000000000000000000000001",
  94857. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94858. },
  94859. "port_directions": {
  94860. "I0": "input",
  94861. "I1": "input",
  94862. "I2": "input",
  94863. "I3": "input",
  94864. "O": "output"
  94865. },
  94866. "connections": {
  94867. "I0": [ 4286 ],
  94868. "I1": [ 4287 ],
  94869. "I2": [ 4288 ],
  94870. "I3": [ 4289 ],
  94871. "O": [ 4283 ]
  94872. }
  94873. },
  94874. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2": {
  94875. "hide_name": 0,
  94876. "type": "SB_LUT4",
  94877. "parameters": {
  94878. "LUT_INIT": "1100110000001100"
  94879. },
  94880. "attributes": {
  94881. "module_not_derived": "00000000000000000000000000000001",
  94882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  94883. },
  94884. "port_directions": {
  94885. "I0": "input",
  94886. "I1": "input",
  94887. "I2": "input",
  94888. "I3": "input",
  94889. "O": "output"
  94890. },
  94891. "connections": {
  94892. "I0": [ "0" ],
  94893. "I1": [ 3968 ],
  94894. "I2": [ 4286 ],
  94895. "I3": [ 4290 ],
  94896. "O": [ 4287 ]
  94897. }
  94898. },
  94899. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_I3_SB_LUT4_O": {
  94900. "hide_name": 0,
  94901. "type": "SB_LUT4",
  94902. "parameters": {
  94903. "LUT_INIT": "0100000000000000"
  94904. },
  94905. "attributes": {
  94906. "module_not_derived": "00000000000000000000000000000001",
  94907. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94908. },
  94909. "port_directions": {
  94910. "I0": "input",
  94911. "I1": "input",
  94912. "I2": "input",
  94913. "I3": "input",
  94914. "O": "output"
  94915. },
  94916. "connections": {
  94917. "I0": [ 2781 ],
  94918. "I1": [ 4291 ],
  94919. "I2": [ 4292 ],
  94920. "I3": [ 4293 ],
  94921. "O": [ 4290 ]
  94922. }
  94923. },
  94924. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_I3_SB_LUT4_O_I1_SB_LUT4_O": {
  94925. "hide_name": 0,
  94926. "type": "SB_LUT4",
  94927. "parameters": {
  94928. "LUT_INIT": "1000000000000000"
  94929. },
  94930. "attributes": {
  94931. "module_not_derived": "00000000000000000000000000000001",
  94932. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94933. },
  94934. "port_directions": {
  94935. "I0": "input",
  94936. "I1": "input",
  94937. "I2": "input",
  94938. "I3": "input",
  94939. "O": "output"
  94940. },
  94941. "connections": {
  94942. "I0": [ 4294 ],
  94943. "I1": [ 4295 ],
  94944. "I2": [ 4296 ],
  94945. "I3": [ 4297 ],
  94946. "O": [ 4293 ]
  94947. }
  94948. },
  94949. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_I3_SB_LUT4_O_I1_SB_LUT4_O_1": {
  94950. "hide_name": 0,
  94951. "type": "SB_LUT4",
  94952. "parameters": {
  94953. "LUT_INIT": "0000000100000000"
  94954. },
  94955. "attributes": {
  94956. "module_not_derived": "00000000000000000000000000000001",
  94957. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94958. },
  94959. "port_directions": {
  94960. "I0": "input",
  94961. "I1": "input",
  94962. "I2": "input",
  94963. "I3": "input",
  94964. "O": "output"
  94965. },
  94966. "connections": {
  94967. "I0": [ 2993 ],
  94968. "I1": [ 4298 ],
  94969. "I2": [ 4299 ],
  94970. "I3": [ 4300 ],
  94971. "O": [ 4291 ]
  94972. }
  94973. },
  94974. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_I3_SB_LUT4_O_I1_SB_LUT4_O_2": {
  94975. "hide_name": 0,
  94976. "type": "SB_LUT4",
  94977. "parameters": {
  94978. "LUT_INIT": "0001000000000000"
  94979. },
  94980. "attributes": {
  94981. "module_not_derived": "00000000000000000000000000000001",
  94982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  94983. },
  94984. "port_directions": {
  94985. "I0": "input",
  94986. "I1": "input",
  94987. "I2": "input",
  94988. "I3": "input",
  94989. "O": "output"
  94990. },
  94991. "connections": {
  94992. "I0": [ 2951 ],
  94993. "I1": [ 3032 ],
  94994. "I2": [ 3009 ],
  94995. "I3": [ 3013 ],
  94996. "O": [ 4292 ]
  94997. }
  94998. },
  94999. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O": {
  95000. "hide_name": 0,
  95001. "type": "SB_LUT4",
  95002. "parameters": {
  95003. "LUT_INIT": "1010101010100001"
  95004. },
  95005. "attributes": {
  95006. "module_not_derived": "00000000000000000000000000000001",
  95007. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95008. },
  95009. "port_directions": {
  95010. "I0": "input",
  95011. "I1": "input",
  95012. "I2": "input",
  95013. "I3": "input",
  95014. "O": "output"
  95015. },
  95016. "connections": {
  95017. "I0": [ 4301 ],
  95018. "I1": [ 4302 ],
  95019. "I2": [ 2778 ],
  95020. "I3": [ 2779 ],
  95021. "O": [ 4289 ]
  95022. }
  95023. },
  95024. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_1": {
  95025. "hide_name": 0,
  95026. "type": "SB_LUT4",
  95027. "parameters": {
  95028. "LUT_INIT": "0000000000110000"
  95029. },
  95030. "attributes": {
  95031. "module_not_derived": "00000000000000000000000000000001",
  95032. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95033. },
  95034. "port_directions": {
  95035. "I0": "input",
  95036. "I1": "input",
  95037. "I2": "input",
  95038. "I3": "input",
  95039. "O": "output"
  95040. },
  95041. "connections": {
  95042. "I0": [ "0" ],
  95043. "I1": [ 962 ],
  95044. "I2": [ 4302 ],
  95045. "I3": [ 4290 ],
  95046. "O": [ 4288 ]
  95047. }
  95048. },
  95049. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_I0_SB_LUT4_O": {
  95050. "hide_name": 0,
  95051. "type": "SB_LUT4",
  95052. "parameters": {
  95053. "LUT_INIT": "1111000000000000"
  95054. },
  95055. "attributes": {
  95056. "module_not_derived": "00000000000000000000000000000001",
  95057. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  95058. },
  95059. "port_directions": {
  95060. "I0": "input",
  95061. "I1": "input",
  95062. "I2": "input",
  95063. "I3": "input",
  95064. "O": "output"
  95065. },
  95066. "connections": {
  95067. "I0": [ "0" ],
  95068. "I1": [ "0" ],
  95069. "I2": [ 962 ],
  95070. "I3": [ 966 ],
  95071. "O": [ 4301 ]
  95072. }
  95073. },
  95074. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_LUT4_I3": {
  95075. "hide_name": 0,
  95076. "type": "SB_LUT4",
  95077. "parameters": {
  95078. "LUT_INIT": "1111000000000000"
  95079. },
  95080. "attributes": {
  95081. "module_not_derived": "00000000000000000000000000000001",
  95082. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  95083. },
  95084. "port_directions": {
  95085. "I0": "input",
  95086. "I1": "input",
  95087. "I2": "input",
  95088. "I3": "input",
  95089. "O": "output"
  95090. },
  95091. "connections": {
  95092. "I0": [ "0" ],
  95093. "I1": [ "0" ],
  95094. "I2": [ 3661 ],
  95095. "I3": [ 4302 ],
  95096. "O": [ 4303 ]
  95097. }
  95098. },
  95099. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_LUT4_O": {
  95100. "hide_name": 0,
  95101. "type": "SB_LUT4",
  95102. "parameters": {
  95103. "LUT_INIT": "0000111100000000"
  95104. },
  95105. "attributes": {
  95106. "module_not_derived": "00000000000000000000000000000001",
  95107. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  95108. },
  95109. "port_directions": {
  95110. "I0": "input",
  95111. "I1": "input",
  95112. "I2": "input",
  95113. "I3": "input",
  95114. "O": "output"
  95115. },
  95116. "connections": {
  95117. "I0": [ "0" ],
  95118. "I1": [ "0" ],
  95119. "I2": [ 964 ],
  95120. "I3": [ 966 ],
  95121. "O": [ 4302 ]
  95122. }
  95123. },
  95124. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_O": {
  95125. "hide_name": 0,
  95126. "type": "SB_LUT4",
  95127. "parameters": {
  95128. "LUT_INIT": "0000000000000011"
  95129. },
  95130. "attributes": {
  95131. "module_not_derived": "00000000000000000000000000000001",
  95132. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95133. },
  95134. "port_directions": {
  95135. "I0": "input",
  95136. "I1": "input",
  95137. "I2": "input",
  95138. "I3": "input",
  95139. "O": "output"
  95140. },
  95141. "connections": {
  95142. "I0": [ "0" ],
  95143. "I1": [ 962 ],
  95144. "I2": [ 964 ],
  95145. "I3": [ 966 ],
  95146. "O": [ 4286 ]
  95147. }
  95148. },
  95149. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  95150. "hide_name": 0,
  95151. "type": "SB_LUT4",
  95152. "parameters": {
  95153. "LUT_INIT": "1111011100000000"
  95154. },
  95155. "attributes": {
  95156. "module_not_derived": "00000000000000000000000000000001",
  95157. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95158. },
  95159. "port_directions": {
  95160. "I0": "input",
  95161. "I1": "input",
  95162. "I2": "input",
  95163. "I3": "input",
  95164. "O": "output"
  95165. },
  95166. "connections": {
  95167. "I0": [ 948 ],
  95168. "I1": [ 3967 ],
  95169. "I2": [ 3968 ],
  95170. "I3": [ 4304 ],
  95171. "O": [ 4285 ]
  95172. }
  95173. },
  95174. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  95175. "hide_name": 0,
  95176. "type": "SB_LUT4",
  95177. "parameters": {
  95178. "LUT_INIT": "1111001100000000"
  95179. },
  95180. "attributes": {
  95181. "module_not_derived": "00000000000000000000000000000001",
  95182. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95183. },
  95184. "port_directions": {
  95185. "I0": "input",
  95186. "I1": "input",
  95187. "I2": "input",
  95188. "I3": "input",
  95189. "O": "output"
  95190. },
  95191. "connections": {
  95192. "I0": [ "0" ],
  95193. "I1": [ 976 ],
  95194. "I2": [ 3967 ],
  95195. "I3": [ 4267 ],
  95196. "O": [ 4304 ]
  95197. }
  95198. },
  95199. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O": {
  95200. "hide_name": 0,
  95201. "type": "SB_LUT4",
  95202. "parameters": {
  95203. "LUT_INIT": "0110100110010110"
  95204. },
  95205. "attributes": {
  95206. "module_not_derived": "00000000000000000000000000000001",
  95207. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95208. },
  95209. "port_directions": {
  95210. "I0": "input",
  95211. "I1": "input",
  95212. "I2": "input",
  95213. "I3": "input",
  95214. "O": "output"
  95215. },
  95216. "connections": {
  95217. "I0": [ "0" ],
  95218. "I1": [ 4305 ],
  95219. "I2": [ 4306 ],
  95220. "I3": [ 4307 ],
  95221. "O": [ 4308 ]
  95222. }
  95223. },
  95224. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1": {
  95225. "hide_name": 0,
  95226. "type": "SB_LUT4",
  95227. "parameters": {
  95228. "LUT_INIT": "0110100110010110"
  95229. },
  95230. "attributes": {
  95231. "module_not_derived": "00000000000000000000000000000001",
  95232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95233. },
  95234. "port_directions": {
  95235. "I0": "input",
  95236. "I1": "input",
  95237. "I2": "input",
  95238. "I3": "input",
  95239. "O": "output"
  95240. },
  95241. "connections": {
  95242. "I0": [ "0" ],
  95243. "I1": [ 4309 ],
  95244. "I2": [ 4310 ],
  95245. "I3": [ 4311 ],
  95246. "O": [ 4312 ]
  95247. }
  95248. },
  95249. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10": {
  95250. "hide_name": 0,
  95251. "type": "SB_LUT4",
  95252. "parameters": {
  95253. "LUT_INIT": "0110100110010110"
  95254. },
  95255. "attributes": {
  95256. "module_not_derived": "00000000000000000000000000000001",
  95257. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95258. },
  95259. "port_directions": {
  95260. "I0": "input",
  95261. "I1": "input",
  95262. "I2": "input",
  95263. "I3": "input",
  95264. "O": "output"
  95265. },
  95266. "connections": {
  95267. "I0": [ "0" ],
  95268. "I1": [ 4313 ],
  95269. "I2": [ 4314 ],
  95270. "I3": [ 4315 ],
  95271. "O": [ 4316 ]
  95272. }
  95273. },
  95274. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I1_SB_LUT4_O": {
  95275. "hide_name": 0,
  95276. "type": "SB_LUT4",
  95277. "parameters": {
  95278. "LUT_INIT": "1100110011110000"
  95279. },
  95280. "attributes": {
  95281. "module_not_derived": "00000000000000000000000000000001",
  95282. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95283. },
  95284. "port_directions": {
  95285. "I0": "input",
  95286. "I1": "input",
  95287. "I2": "input",
  95288. "I3": "input",
  95289. "O": "output"
  95290. },
  95291. "connections": {
  95292. "I0": [ "0" ],
  95293. "I1": [ 4059 ],
  95294. "I2": [ 4253 ],
  95295. "I3": [ 3969 ],
  95296. "O": [ 4313 ]
  95297. }
  95298. },
  95299. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I1_SB_LUT4_O_1": {
  95300. "hide_name": 0,
  95301. "type": "SB_LUT4",
  95302. "parameters": {
  95303. "LUT_INIT": "1010000010100011"
  95304. },
  95305. "attributes": {
  95306. "module_not_derived": "00000000000000000000000000000001",
  95307. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95308. },
  95309. "port_directions": {
  95310. "I0": "input",
  95311. "I1": "input",
  95312. "I2": "input",
  95313. "I3": "input",
  95314. "O": "output"
  95315. },
  95316. "connections": {
  95317. "I0": [ 943 ],
  95318. "I1": [ 4267 ],
  95319. "I2": [ 3969 ],
  95320. "I3": [ 4317 ],
  95321. "O": [ 4314 ]
  95322. }
  95323. },
  95324. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  95325. "hide_name": 0,
  95326. "type": "SB_LUT4",
  95327. "parameters": {
  95328. "LUT_INIT": "0101010100110101"
  95329. },
  95330. "attributes": {
  95331. "module_not_derived": "00000000000000000000000000000001",
  95332. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95333. },
  95334. "port_directions": {
  95335. "I0": "input",
  95336. "I1": "input",
  95337. "I2": "input",
  95338. "I3": "input",
  95339. "O": "output"
  95340. },
  95341. "connections": {
  95342. "I0": [ 943 ],
  95343. "I1": [ 954 ],
  95344. "I2": [ 3967 ],
  95345. "I3": [ 3968 ],
  95346. "O": [ 4317 ]
  95347. }
  95348. },
  95349. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  95350. "hide_name": 0,
  95351. "type": "SB_CARRY",
  95352. "parameters": {
  95353. },
  95354. "attributes": {
  95355. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95356. },
  95357. "port_directions": {
  95358. "CI": "input",
  95359. "CO": "output",
  95360. "I0": "input",
  95361. "I1": "input"
  95362. },
  95363. "connections": {
  95364. "CI": [ 4318 ],
  95365. "CO": [ 4315 ],
  95366. "I0": [ 4319 ],
  95367. "I1": [ 4320 ]
  95368. }
  95369. },
  95370. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11": {
  95371. "hide_name": 0,
  95372. "type": "SB_LUT4",
  95373. "parameters": {
  95374. "LUT_INIT": "0110100110010110"
  95375. },
  95376. "attributes": {
  95377. "module_not_derived": "00000000000000000000000000000001",
  95378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95379. },
  95380. "port_directions": {
  95381. "I0": "input",
  95382. "I1": "input",
  95383. "I2": "input",
  95384. "I3": "input",
  95385. "O": "output"
  95386. },
  95387. "connections": {
  95388. "I0": [ "0" ],
  95389. "I1": [ 4321 ],
  95390. "I2": [ 4322 ],
  95391. "I3": [ 4323 ],
  95392. "O": [ 4324 ]
  95393. }
  95394. },
  95395. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I1_SB_LUT4_O": {
  95396. "hide_name": 0,
  95397. "type": "SB_LUT4",
  95398. "parameters": {
  95399. "LUT_INIT": "1111000011001100"
  95400. },
  95401. "attributes": {
  95402. "module_not_derived": "00000000000000000000000000000001",
  95403. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95404. },
  95405. "port_directions": {
  95406. "I0": "input",
  95407. "I1": "input",
  95408. "I2": "input",
  95409. "I3": "input",
  95410. "O": "output"
  95411. },
  95412. "connections": {
  95413. "I0": [ "0" ],
  95414. "I1": [ 4252 ],
  95415. "I2": [ 4054 ],
  95416. "I3": [ 3969 ],
  95417. "O": [ 4321 ]
  95418. }
  95419. },
  95420. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I1_SB_LUT4_O_1": {
  95421. "hide_name": 0,
  95422. "type": "SB_LUT4",
  95423. "parameters": {
  95424. "LUT_INIT": "1010000010100011"
  95425. },
  95426. "attributes": {
  95427. "module_not_derived": "00000000000000000000000000000001",
  95428. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95429. },
  95430. "port_directions": {
  95431. "I0": "input",
  95432. "I1": "input",
  95433. "I2": "input",
  95434. "I3": "input",
  95435. "O": "output"
  95436. },
  95437. "connections": {
  95438. "I0": [ 943 ],
  95439. "I1": [ 4267 ],
  95440. "I2": [ 3969 ],
  95441. "I3": [ 4325 ],
  95442. "O": [ 4322 ]
  95443. }
  95444. },
  95445. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  95446. "hide_name": 0,
  95447. "type": "SB_LUT4",
  95448. "parameters": {
  95449. "LUT_INIT": "0101010100110101"
  95450. },
  95451. "attributes": {
  95452. "module_not_derived": "00000000000000000000000000000001",
  95453. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95454. },
  95455. "port_directions": {
  95456. "I0": "input",
  95457. "I1": "input",
  95458. "I2": "input",
  95459. "I3": "input",
  95460. "O": "output"
  95461. },
  95462. "connections": {
  95463. "I0": [ 943 ],
  95464. "I1": [ 952 ],
  95465. "I2": [ 3967 ],
  95466. "I3": [ 3968 ],
  95467. "O": [ 4325 ]
  95468. }
  95469. },
  95470. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  95471. "hide_name": 0,
  95472. "type": "SB_CARRY",
  95473. "parameters": {
  95474. },
  95475. "attributes": {
  95476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95477. },
  95478. "port_directions": {
  95479. "CI": "input",
  95480. "CO": "output",
  95481. "I0": "input",
  95482. "I1": "input"
  95483. },
  95484. "connections": {
  95485. "CI": [ 4315 ],
  95486. "CO": [ 4323 ],
  95487. "I0": [ 4313 ],
  95488. "I1": [ 4314 ]
  95489. }
  95490. },
  95491. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_12": {
  95492. "hide_name": 0,
  95493. "type": "SB_LUT4",
  95494. "parameters": {
  95495. "LUT_INIT": "0110100110010110"
  95496. },
  95497. "attributes": {
  95498. "module_not_derived": "00000000000000000000000000000001",
  95499. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95500. },
  95501. "port_directions": {
  95502. "I0": "input",
  95503. "I1": "input",
  95504. "I2": "input",
  95505. "I3": "input",
  95506. "O": "output"
  95507. },
  95508. "connections": {
  95509. "I0": [ "0" ],
  95510. "I1": [ 4326 ],
  95511. "I2": [ 4306 ],
  95512. "I3": [ 4327 ],
  95513. "O": [ 4328 ]
  95514. }
  95515. },
  95516. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_12_I1_SB_LUT4_O": {
  95517. "hide_name": 0,
  95518. "type": "SB_LUT4",
  95519. "parameters": {
  95520. "LUT_INIT": "1111000011001100"
  95521. },
  95522. "attributes": {
  95523. "module_not_derived": "00000000000000000000000000000001",
  95524. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95525. },
  95526. "port_directions": {
  95527. "I0": "input",
  95528. "I1": "input",
  95529. "I2": "input",
  95530. "I3": "input",
  95531. "O": "output"
  95532. },
  95533. "connections": {
  95534. "I0": [ "0" ],
  95535. "I1": [ 2932 ],
  95536. "I2": [ 2851 ],
  95537. "I3": [ 3969 ],
  95538. "O": [ 4326 ]
  95539. }
  95540. },
  95541. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  95542. "hide_name": 0,
  95543. "type": "SB_CARRY",
  95544. "parameters": {
  95545. },
  95546. "attributes": {
  95547. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95548. },
  95549. "port_directions": {
  95550. "CI": "input",
  95551. "CO": "output",
  95552. "I0": "input",
  95553. "I1": "input"
  95554. },
  95555. "connections": {
  95556. "CI": [ 4323 ],
  95557. "CO": [ 4327 ],
  95558. "I0": [ 4321 ],
  95559. "I1": [ 4322 ]
  95560. }
  95561. },
  95562. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_13": {
  95563. "hide_name": 0,
  95564. "type": "SB_LUT4",
  95565. "parameters": {
  95566. "LUT_INIT": "0110100110010110"
  95567. },
  95568. "attributes": {
  95569. "module_not_derived": "00000000000000000000000000000001",
  95570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95571. },
  95572. "port_directions": {
  95573. "I0": "input",
  95574. "I1": "input",
  95575. "I2": "input",
  95576. "I3": "input",
  95577. "O": "output"
  95578. },
  95579. "connections": {
  95580. "I0": [ "0" ],
  95581. "I1": [ 4329 ],
  95582. "I2": [ 4306 ],
  95583. "I3": [ 4330 ],
  95584. "O": [ 4331 ]
  95585. }
  95586. },
  95587. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_13_I1_SB_LUT4_O": {
  95588. "hide_name": 0,
  95589. "type": "SB_LUT4",
  95590. "parameters": {
  95591. "LUT_INIT": "1111000011001100"
  95592. },
  95593. "attributes": {
  95594. "module_not_derived": "00000000000000000000000000000001",
  95595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95596. },
  95597. "port_directions": {
  95598. "I0": "input",
  95599. "I1": "input",
  95600. "I2": "input",
  95601. "I3": "input",
  95602. "O": "output"
  95603. },
  95604. "connections": {
  95605. "I0": [ "0" ],
  95606. "I1": [ 4251 ],
  95607. "I2": [ 4038 ],
  95608. "I3": [ 3969 ],
  95609. "O": [ 4329 ]
  95610. }
  95611. },
  95612. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  95613. "hide_name": 0,
  95614. "type": "SB_CARRY",
  95615. "parameters": {
  95616. },
  95617. "attributes": {
  95618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95619. },
  95620. "port_directions": {
  95621. "CI": "input",
  95622. "CO": "output",
  95623. "I0": "input",
  95624. "I1": "input"
  95625. },
  95626. "connections": {
  95627. "CI": [ 4327 ],
  95628. "CO": [ 4330 ],
  95629. "I0": [ 4326 ],
  95630. "I1": [ 4306 ]
  95631. }
  95632. },
  95633. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_14": {
  95634. "hide_name": 0,
  95635. "type": "SB_LUT4",
  95636. "parameters": {
  95637. "LUT_INIT": "0110100110010110"
  95638. },
  95639. "attributes": {
  95640. "module_not_derived": "00000000000000000000000000000001",
  95641. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95642. },
  95643. "port_directions": {
  95644. "I0": "input",
  95645. "I1": "input",
  95646. "I2": "input",
  95647. "I3": "input",
  95648. "O": "output"
  95649. },
  95650. "connections": {
  95651. "I0": [ "0" ],
  95652. "I1": [ 4332 ],
  95653. "I2": [ 4306 ],
  95654. "I3": [ 4333 ],
  95655. "O": [ 4334 ]
  95656. }
  95657. },
  95658. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_14_I1_SB_LUT4_O": {
  95659. "hide_name": 0,
  95660. "type": "SB_LUT4",
  95661. "parameters": {
  95662. "LUT_INIT": "1111000011001100"
  95663. },
  95664. "attributes": {
  95665. "module_not_derived": "00000000000000000000000000000001",
  95666. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95667. },
  95668. "port_directions": {
  95669. "I0": "input",
  95670. "I1": "input",
  95671. "I2": "input",
  95672. "I3": "input",
  95673. "O": "output"
  95674. },
  95675. "connections": {
  95676. "I0": [ "0" ],
  95677. "I1": [ 4266 ],
  95678. "I2": [ 4033 ],
  95679. "I3": [ 3969 ],
  95680. "O": [ 4332 ]
  95681. }
  95682. },
  95683. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  95684. "hide_name": 0,
  95685. "type": "SB_CARRY",
  95686. "parameters": {
  95687. },
  95688. "attributes": {
  95689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95690. },
  95691. "port_directions": {
  95692. "CI": "input",
  95693. "CO": "output",
  95694. "I0": "input",
  95695. "I1": "input"
  95696. },
  95697. "connections": {
  95698. "CI": [ 4330 ],
  95699. "CO": [ 4333 ],
  95700. "I0": [ 4329 ],
  95701. "I1": [ 4306 ]
  95702. }
  95703. },
  95704. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_15": {
  95705. "hide_name": 0,
  95706. "type": "SB_LUT4",
  95707. "parameters": {
  95708. "LUT_INIT": "0110100110010110"
  95709. },
  95710. "attributes": {
  95711. "module_not_derived": "00000000000000000000000000000001",
  95712. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95713. },
  95714. "port_directions": {
  95715. "I0": "input",
  95716. "I1": "input",
  95717. "I2": "input",
  95718. "I3": "input",
  95719. "O": "output"
  95720. },
  95721. "connections": {
  95722. "I0": [ "0" ],
  95723. "I1": [ 4335 ],
  95724. "I2": [ 4306 ],
  95725. "I3": [ 4336 ],
  95726. "O": [ 4337 ]
  95727. }
  95728. },
  95729. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_15_I1_SB_LUT4_O": {
  95730. "hide_name": 0,
  95731. "type": "SB_LUT4",
  95732. "parameters": {
  95733. "LUT_INIT": "1111000011001100"
  95734. },
  95735. "attributes": {
  95736. "module_not_derived": "00000000000000000000000000000001",
  95737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95738. },
  95739. "port_directions": {
  95740. "I0": "input",
  95741. "I1": "input",
  95742. "I2": "input",
  95743. "I3": "input",
  95744. "O": "output"
  95745. },
  95746. "connections": {
  95747. "I0": [ "0" ],
  95748. "I1": [ 2952 ],
  95749. "I2": [ 4028 ],
  95750. "I3": [ 3969 ],
  95751. "O": [ 4335 ]
  95752. }
  95753. },
  95754. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  95755. "hide_name": 0,
  95756. "type": "SB_CARRY",
  95757. "parameters": {
  95758. },
  95759. "attributes": {
  95760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95761. },
  95762. "port_directions": {
  95763. "CI": "input",
  95764. "CO": "output",
  95765. "I0": "input",
  95766. "I1": "input"
  95767. },
  95768. "connections": {
  95769. "CI": [ 4333 ],
  95770. "CO": [ 4336 ],
  95771. "I0": [ 4332 ],
  95772. "I1": [ 4306 ]
  95773. }
  95774. },
  95775. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_16": {
  95776. "hide_name": 0,
  95777. "type": "SB_LUT4",
  95778. "parameters": {
  95779. "LUT_INIT": "0110100110010110"
  95780. },
  95781. "attributes": {
  95782. "module_not_derived": "00000000000000000000000000000001",
  95783. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95784. },
  95785. "port_directions": {
  95786. "I0": "input",
  95787. "I1": "input",
  95788. "I2": "input",
  95789. "I3": "input",
  95790. "O": "output"
  95791. },
  95792. "connections": {
  95793. "I0": [ "0" ],
  95794. "I1": [ 4338 ],
  95795. "I2": [ 4306 ],
  95796. "I3": [ 4339 ],
  95797. "O": [ 4340 ]
  95798. }
  95799. },
  95800. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_16_I1_SB_LUT4_O": {
  95801. "hide_name": 0,
  95802. "type": "SB_LUT4",
  95803. "parameters": {
  95804. "LUT_INIT": "1100110011110000"
  95805. },
  95806. "attributes": {
  95807. "module_not_derived": "00000000000000000000000000000001",
  95808. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95809. },
  95810. "port_directions": {
  95811. "I0": "input",
  95812. "I1": "input",
  95813. "I2": "input",
  95814. "I3": "input",
  95815. "O": "output"
  95816. },
  95817. "connections": {
  95818. "I0": [ "0" ],
  95819. "I1": [ 2845 ],
  95820. "I2": [ 4265 ],
  95821. "I3": [ 3969 ],
  95822. "O": [ 4338 ]
  95823. }
  95824. },
  95825. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  95826. "hide_name": 0,
  95827. "type": "SB_CARRY",
  95828. "parameters": {
  95829. },
  95830. "attributes": {
  95831. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95832. },
  95833. "port_directions": {
  95834. "CI": "input",
  95835. "CO": "output",
  95836. "I0": "input",
  95837. "I1": "input"
  95838. },
  95839. "connections": {
  95840. "CI": [ 4336 ],
  95841. "CO": [ 4339 ],
  95842. "I0": [ 4335 ],
  95843. "I1": [ 4306 ]
  95844. }
  95845. },
  95846. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_17": {
  95847. "hide_name": 0,
  95848. "type": "SB_LUT4",
  95849. "parameters": {
  95850. "LUT_INIT": "0110100110010110"
  95851. },
  95852. "attributes": {
  95853. "module_not_derived": "00000000000000000000000000000001",
  95854. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95855. },
  95856. "port_directions": {
  95857. "I0": "input",
  95858. "I1": "input",
  95859. "I2": "input",
  95860. "I3": "input",
  95861. "O": "output"
  95862. },
  95863. "connections": {
  95864. "I0": [ "0" ],
  95865. "I1": [ 4341 ],
  95866. "I2": [ 4306 ],
  95867. "I3": [ 4342 ],
  95868. "O": [ 4343 ]
  95869. }
  95870. },
  95871. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_17_I1_SB_LUT4_O": {
  95872. "hide_name": 0,
  95873. "type": "SB_LUT4",
  95874. "parameters": {
  95875. "LUT_INIT": "1111000011001100"
  95876. },
  95877. "attributes": {
  95878. "module_not_derived": "00000000000000000000000000000001",
  95879. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95880. },
  95881. "port_directions": {
  95882. "I0": "input",
  95883. "I1": "input",
  95884. "I2": "input",
  95885. "I3": "input",
  95886. "O": "output"
  95887. },
  95888. "connections": {
  95889. "I0": [ "0" ],
  95890. "I1": [ 4264 ],
  95891. "I2": [ 4019 ],
  95892. "I3": [ 3969 ],
  95893. "O": [ 4341 ]
  95894. }
  95895. },
  95896. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_17_I3_SB_CARRY_CO": {
  95897. "hide_name": 0,
  95898. "type": "SB_CARRY",
  95899. "parameters": {
  95900. },
  95901. "attributes": {
  95902. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95903. },
  95904. "port_directions": {
  95905. "CI": "input",
  95906. "CO": "output",
  95907. "I0": "input",
  95908. "I1": "input"
  95909. },
  95910. "connections": {
  95911. "CI": [ 4339 ],
  95912. "CO": [ 4342 ],
  95913. "I0": [ 4338 ],
  95914. "I1": [ 4306 ]
  95915. }
  95916. },
  95917. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_18": {
  95918. "hide_name": 0,
  95919. "type": "SB_LUT4",
  95920. "parameters": {
  95921. "LUT_INIT": "0110100110010110"
  95922. },
  95923. "attributes": {
  95924. "module_not_derived": "00000000000000000000000000000001",
  95925. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95926. },
  95927. "port_directions": {
  95928. "I0": "input",
  95929. "I1": "input",
  95930. "I2": "input",
  95931. "I3": "input",
  95932. "O": "output"
  95933. },
  95934. "connections": {
  95935. "I0": [ "0" ],
  95936. "I1": [ 4344 ],
  95937. "I2": [ 4306 ],
  95938. "I3": [ 4345 ],
  95939. "O": [ 4346 ]
  95940. }
  95941. },
  95942. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_18_I1_SB_LUT4_O": {
  95943. "hide_name": 0,
  95944. "type": "SB_LUT4",
  95945. "parameters": {
  95946. "LUT_INIT": "1100110011110000"
  95947. },
  95948. "attributes": {
  95949. "module_not_derived": "00000000000000000000000000000001",
  95950. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  95951. },
  95952. "port_directions": {
  95953. "I0": "input",
  95954. "I1": "input",
  95955. "I2": "input",
  95956. "I3": "input",
  95957. "O": "output"
  95958. },
  95959. "connections": {
  95960. "I0": [ "0" ],
  95961. "I1": [ 4014 ],
  95962. "I2": [ 4263 ],
  95963. "I3": [ 3969 ],
  95964. "O": [ 4344 ]
  95965. }
  95966. },
  95967. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_18_I3_SB_CARRY_CO": {
  95968. "hide_name": 0,
  95969. "type": "SB_CARRY",
  95970. "parameters": {
  95971. },
  95972. "attributes": {
  95973. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  95974. },
  95975. "port_directions": {
  95976. "CI": "input",
  95977. "CO": "output",
  95978. "I0": "input",
  95979. "I1": "input"
  95980. },
  95981. "connections": {
  95982. "CI": [ 4342 ],
  95983. "CO": [ 4345 ],
  95984. "I0": [ 4341 ],
  95985. "I1": [ 4306 ]
  95986. }
  95987. },
  95988. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_19": {
  95989. "hide_name": 0,
  95990. "type": "SB_LUT4",
  95991. "parameters": {
  95992. "LUT_INIT": "0110100110010110"
  95993. },
  95994. "attributes": {
  95995. "module_not_derived": "00000000000000000000000000000001",
  95996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  95997. },
  95998. "port_directions": {
  95999. "I0": "input",
  96000. "I1": "input",
  96001. "I2": "input",
  96002. "I3": "input",
  96003. "O": "output"
  96004. },
  96005. "connections": {
  96006. "I0": [ "0" ],
  96007. "I1": [ 4347 ],
  96008. "I2": [ 4306 ],
  96009. "I3": [ 4348 ],
  96010. "O": [ 4349 ]
  96011. }
  96012. },
  96013. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_19_I1_SB_LUT4_O": {
  96014. "hide_name": 0,
  96015. "type": "SB_LUT4",
  96016. "parameters": {
  96017. "LUT_INIT": "1100110011110000"
  96018. },
  96019. "attributes": {
  96020. "module_not_derived": "00000000000000000000000000000001",
  96021. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96022. },
  96023. "port_directions": {
  96024. "I0": "input",
  96025. "I1": "input",
  96026. "I2": "input",
  96027. "I3": "input",
  96028. "O": "output"
  96029. },
  96030. "connections": {
  96031. "I0": [ "0" ],
  96032. "I1": [ 4009 ],
  96033. "I2": [ 4262 ],
  96034. "I3": [ 3969 ],
  96035. "O": [ 4347 ]
  96036. }
  96037. },
  96038. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_19_I3_SB_CARRY_CO": {
  96039. "hide_name": 0,
  96040. "type": "SB_CARRY",
  96041. "parameters": {
  96042. },
  96043. "attributes": {
  96044. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96045. },
  96046. "port_directions": {
  96047. "CI": "input",
  96048. "CO": "output",
  96049. "I0": "input",
  96050. "I1": "input"
  96051. },
  96052. "connections": {
  96053. "CI": [ 4345 ],
  96054. "CO": [ 4348 ],
  96055. "I0": [ 4344 ],
  96056. "I1": [ 4306 ]
  96057. }
  96058. },
  96059. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O": {
  96060. "hide_name": 0,
  96061. "type": "SB_LUT4",
  96062. "parameters": {
  96063. "LUT_INIT": "1111000011001100"
  96064. },
  96065. "attributes": {
  96066. "module_not_derived": "00000000000000000000000000000001",
  96067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96068. },
  96069. "port_directions": {
  96070. "I0": "input",
  96071. "I1": "input",
  96072. "I2": "input",
  96073. "I3": "input",
  96074. "O": "output"
  96075. },
  96076. "connections": {
  96077. "I0": [ "0" ],
  96078. "I1": [ 4258 ],
  96079. "I2": [ 4047 ],
  96080. "I3": [ 3969 ],
  96081. "O": [ 4309 ]
  96082. }
  96083. },
  96084. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O_1": {
  96085. "hide_name": 0,
  96086. "type": "SB_LUT4",
  96087. "parameters": {
  96088. "LUT_INIT": "0000000011110000"
  96089. },
  96090. "attributes": {
  96091. "module_not_derived": "00000000000000000000000000000001",
  96092. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96093. },
  96094. "port_directions": {
  96095. "I0": "input",
  96096. "I1": "input",
  96097. "I2": "input",
  96098. "I3": "input",
  96099. "O": "output"
  96100. },
  96101. "connections": {
  96102. "I0": [ "0" ],
  96103. "I1": [ "0" ],
  96104. "I2": [ 968 ],
  96105. "I3": [ 4350 ],
  96106. "O": [ 4310 ]
  96107. }
  96108. },
  96109. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O_1_I3_SB_LUT4_I3": {
  96110. "hide_name": 0,
  96111. "type": "SB_LUT4",
  96112. "parameters": {
  96113. "LUT_INIT": "0000000011110000"
  96114. },
  96115. "attributes": {
  96116. "module_not_derived": "00000000000000000000000000000001",
  96117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96118. },
  96119. "port_directions": {
  96120. "I0": "input",
  96121. "I1": "input",
  96122. "I2": "input",
  96123. "I3": "input",
  96124. "O": "output"
  96125. },
  96126. "connections": {
  96127. "I0": [ "0" ],
  96128. "I1": [ "0" ],
  96129. "I2": [ 943 ],
  96130. "I3": [ 4350 ],
  96131. "O": [ 4306 ]
  96132. }
  96133. },
  96134. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O_1_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  96135. "hide_name": 0,
  96136. "type": "SB_LUT4",
  96137. "parameters": {
  96138. "LUT_INIT": "1111000011001100"
  96139. },
  96140. "attributes": {
  96141. "module_not_derived": "00000000000000000000000000000001",
  96142. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96143. },
  96144. "port_directions": {
  96145. "I0": "input",
  96146. "I1": "input",
  96147. "I2": "input",
  96148. "I3": "input",
  96149. "O": "output"
  96150. },
  96151. "connections": {
  96152. "I0": [ "0" ],
  96153. "I1": [ 4250 ],
  96154. "I2": [ 2771 ],
  96155. "I3": [ 3969 ],
  96156. "O": [ 4351 ]
  96157. }
  96158. },
  96159. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  96160. "hide_name": 0,
  96161. "type": "SB_LUT4",
  96162. "parameters": {
  96163. "LUT_INIT": "0000000011110000"
  96164. },
  96165. "attributes": {
  96166. "module_not_derived": "00000000000000000000000000000001",
  96167. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96168. },
  96169. "port_directions": {
  96170. "I0": "input",
  96171. "I1": "input",
  96172. "I2": "input",
  96173. "I3": "input",
  96174. "O": "output"
  96175. },
  96176. "connections": {
  96177. "I0": [ "0" ],
  96178. "I1": [ "0" ],
  96179. "I2": [ 4267 ],
  96180. "I3": [ 3969 ],
  96181. "O": [ 4350 ]
  96182. }
  96183. },
  96184. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  96185. "hide_name": 0,
  96186. "type": "SB_CARRY",
  96187. "parameters": {
  96188. },
  96189. "attributes": {
  96190. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96191. },
  96192. "port_directions": {
  96193. "CI": "input",
  96194. "CO": "output",
  96195. "I0": "input",
  96196. "I1": "input"
  96197. },
  96198. "connections": {
  96199. "CI": [ 4352 ],
  96200. "CO": [ 4311 ],
  96201. "I0": [ 4353 ],
  96202. "I1": [ 4354 ]
  96203. }
  96204. },
  96205. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_2": {
  96206. "hide_name": 0,
  96207. "type": "SB_LUT4",
  96208. "parameters": {
  96209. "LUT_INIT": "0110100110010110"
  96210. },
  96211. "attributes": {
  96212. "module_not_derived": "00000000000000000000000000000001",
  96213. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96214. },
  96215. "port_directions": {
  96216. "I0": "input",
  96217. "I1": "input",
  96218. "I2": "input",
  96219. "I3": "input",
  96220. "O": "output"
  96221. },
  96222. "connections": {
  96223. "I0": [ "0" ],
  96224. "I1": [ 4355 ],
  96225. "I2": [ 4356 ],
  96226. "I3": [ 4357 ],
  96227. "O": [ 4358 ]
  96228. }
  96229. },
  96230. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_20": {
  96231. "hide_name": 0,
  96232. "type": "SB_LUT4",
  96233. "parameters": {
  96234. "LUT_INIT": "0110100110010110"
  96235. },
  96236. "attributes": {
  96237. "module_not_derived": "00000000000000000000000000000001",
  96238. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96239. },
  96240. "port_directions": {
  96241. "I0": "input",
  96242. "I1": "input",
  96243. "I2": "input",
  96244. "I3": "input",
  96245. "O": "output"
  96246. },
  96247. "connections": {
  96248. "I0": [ "0" ],
  96249. "I1": [ 4359 ],
  96250. "I2": [ 4306 ],
  96251. "I3": [ 4360 ],
  96252. "O": [ 4361 ]
  96253. }
  96254. },
  96255. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_20_I1_SB_LUT4_O": {
  96256. "hide_name": 0,
  96257. "type": "SB_LUT4",
  96258. "parameters": {
  96259. "LUT_INIT": "1111000011001100"
  96260. },
  96261. "attributes": {
  96262. "module_not_derived": "00000000000000000000000000000001",
  96263. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96264. },
  96265. "port_directions": {
  96266. "I0": "input",
  96267. "I1": "input",
  96268. "I2": "input",
  96269. "I3": "input",
  96270. "O": "output"
  96271. },
  96272. "connections": {
  96273. "I0": [ "0" ],
  96274. "I1": [ 2994 ],
  96275. "I2": [ 2849 ],
  96276. "I3": [ 3969 ],
  96277. "O": [ 4359 ]
  96278. }
  96279. },
  96280. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_20_I3_SB_CARRY_CO": {
  96281. "hide_name": 0,
  96282. "type": "SB_CARRY",
  96283. "parameters": {
  96284. },
  96285. "attributes": {
  96286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96287. },
  96288. "port_directions": {
  96289. "CI": "input",
  96290. "CO": "output",
  96291. "I0": "input",
  96292. "I1": "input"
  96293. },
  96294. "connections": {
  96295. "CI": [ 4348 ],
  96296. "CO": [ 4360 ],
  96297. "I0": [ 4347 ],
  96298. "I1": [ 4306 ]
  96299. }
  96300. },
  96301. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_21": {
  96302. "hide_name": 0,
  96303. "type": "SB_LUT4",
  96304. "parameters": {
  96305. "LUT_INIT": "0110100110010110"
  96306. },
  96307. "attributes": {
  96308. "module_not_derived": "00000000000000000000000000000001",
  96309. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96310. },
  96311. "port_directions": {
  96312. "I0": "input",
  96313. "I1": "input",
  96314. "I2": "input",
  96315. "I3": "input",
  96316. "O": "output"
  96317. },
  96318. "connections": {
  96319. "I0": [ "0" ],
  96320. "I1": [ 4362 ],
  96321. "I2": [ 4306 ],
  96322. "I3": [ 4363 ],
  96323. "O": [ 4364 ]
  96324. }
  96325. },
  96326. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_21_I1_SB_LUT4_O": {
  96327. "hide_name": 0,
  96328. "type": "SB_LUT4",
  96329. "parameters": {
  96330. "LUT_INIT": "1100110011110000"
  96331. },
  96332. "attributes": {
  96333. "module_not_derived": "00000000000000000000000000000001",
  96334. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96335. },
  96336. "port_directions": {
  96337. "I0": "input",
  96338. "I1": "input",
  96339. "I2": "input",
  96340. "I3": "input",
  96341. "O": "output"
  96342. },
  96343. "connections": {
  96344. "I0": [ "0" ],
  96345. "I1": [ 2756 ],
  96346. "I2": [ 4257 ],
  96347. "I3": [ 3969 ],
  96348. "O": [ 4362 ]
  96349. }
  96350. },
  96351. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_21_I3_SB_CARRY_CO": {
  96352. "hide_name": 0,
  96353. "type": "SB_CARRY",
  96354. "parameters": {
  96355. },
  96356. "attributes": {
  96357. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96358. },
  96359. "port_directions": {
  96360. "CI": "input",
  96361. "CO": "output",
  96362. "I0": "input",
  96363. "I1": "input"
  96364. },
  96365. "connections": {
  96366. "CI": [ 4360 ],
  96367. "CO": [ 4363 ],
  96368. "I0": [ 4359 ],
  96369. "I1": [ 4306 ]
  96370. }
  96371. },
  96372. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_22": {
  96373. "hide_name": 0,
  96374. "type": "SB_LUT4",
  96375. "parameters": {
  96376. "LUT_INIT": "0110100110010110"
  96377. },
  96378. "attributes": {
  96379. "module_not_derived": "00000000000000000000000000000001",
  96380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96381. },
  96382. "port_directions": {
  96383. "I0": "input",
  96384. "I1": "input",
  96385. "I2": "input",
  96386. "I3": "input",
  96387. "O": "output"
  96388. },
  96389. "connections": {
  96390. "I0": [ "0" ],
  96391. "I1": [ 4351 ],
  96392. "I2": [ 4306 ],
  96393. "I3": [ 4365 ],
  96394. "O": [ 4366 ]
  96395. }
  96396. },
  96397. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_22_I3_SB_CARRY_CO": {
  96398. "hide_name": 0,
  96399. "type": "SB_CARRY",
  96400. "parameters": {
  96401. },
  96402. "attributes": {
  96403. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96404. },
  96405. "port_directions": {
  96406. "CI": "input",
  96407. "CO": "output",
  96408. "I0": "input",
  96409. "I1": "input"
  96410. },
  96411. "connections": {
  96412. "CI": [ 4363 ],
  96413. "CO": [ 4365 ],
  96414. "I0": [ 4362 ],
  96415. "I1": [ 4306 ]
  96416. }
  96417. },
  96418. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23": {
  96419. "hide_name": 0,
  96420. "type": "SB_LUT4",
  96421. "parameters": {
  96422. "LUT_INIT": "0110100110010110"
  96423. },
  96424. "attributes": {
  96425. "module_not_derived": "00000000000000000000000000000001",
  96426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96427. },
  96428. "port_directions": {
  96429. "I0": "input",
  96430. "I1": "input",
  96431. "I2": "input",
  96432. "I3": "input",
  96433. "O": "output"
  96434. },
  96435. "connections": {
  96436. "I0": [ "0" ],
  96437. "I1": [ 4367 ],
  96438. "I2": [ 4368 ],
  96439. "I3": [ 4369 ],
  96440. "O": [ 4370 ]
  96441. }
  96442. },
  96443. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I1_SB_LUT4_O": {
  96444. "hide_name": 0,
  96445. "type": "SB_LUT4",
  96446. "parameters": {
  96447. "LUT_INIT": "1100110011110000"
  96448. },
  96449. "attributes": {
  96450. "module_not_derived": "00000000000000000000000000000001",
  96451. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96452. },
  96453. "port_directions": {
  96454. "I0": "input",
  96455. "I1": "input",
  96456. "I2": "input",
  96457. "I3": "input",
  96458. "O": "output"
  96459. },
  96460. "connections": {
  96461. "I0": [ "0" ],
  96462. "I1": [ 2759 ],
  96463. "I2": [ 4261 ],
  96464. "I3": [ 3969 ],
  96465. "O": [ 4367 ]
  96466. }
  96467. },
  96468. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I1_SB_LUT4_O_1": {
  96469. "hide_name": 0,
  96470. "type": "SB_LUT4",
  96471. "parameters": {
  96472. "LUT_INIT": "1111111110101100"
  96473. },
  96474. "attributes": {
  96475. "module_not_derived": "00000000000000000000000000000001",
  96476. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96477. },
  96478. "port_directions": {
  96479. "I0": "input",
  96480. "I1": "input",
  96481. "I2": "input",
  96482. "I3": "input",
  96483. "O": "output"
  96484. },
  96485. "connections": {
  96486. "I0": [ 1006 ],
  96487. "I1": [ 974 ],
  96488. "I2": [ 3967 ],
  96489. "I3": [ 4350 ],
  96490. "O": [ 4368 ]
  96491. }
  96492. },
  96493. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO": {
  96494. "hide_name": 0,
  96495. "type": "SB_CARRY",
  96496. "parameters": {
  96497. },
  96498. "attributes": {
  96499. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96500. },
  96501. "port_directions": {
  96502. "CI": "input",
  96503. "CO": "output",
  96504. "I0": "input",
  96505. "I1": "input"
  96506. },
  96507. "connections": {
  96508. "CI": [ 4371 ],
  96509. "CO": [ 4369 ],
  96510. "I0": [ 4372 ],
  96511. "I1": [ 4373 ]
  96512. }
  96513. },
  96514. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  96515. "hide_name": 0,
  96516. "type": "SB_CARRY",
  96517. "parameters": {
  96518. },
  96519. "attributes": {
  96520. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96521. },
  96522. "port_directions": {
  96523. "CI": "input",
  96524. "CO": "output",
  96525. "I0": "input",
  96526. "I1": "input"
  96527. },
  96528. "connections": {
  96529. "CI": [ "0" ],
  96530. "CO": [ 4371 ],
  96531. "I0": [ 4374 ],
  96532. "I1": [ 4375 ]
  96533. }
  96534. },
  96535. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  96536. "hide_name": 0,
  96537. "type": "SB_LUT4",
  96538. "parameters": {
  96539. "LUT_INIT": "1111000000000000"
  96540. },
  96541. "attributes": {
  96542. "module_not_derived": "00000000000000000000000000000001",
  96543. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96544. },
  96545. "port_directions": {
  96546. "I0": "input",
  96547. "I1": "input",
  96548. "I2": "input",
  96549. "I3": "input",
  96550. "O": "output"
  96551. },
  96552. "connections": {
  96553. "I0": [ "0" ],
  96554. "I1": [ "0" ],
  96555. "I2": [ 2842 ],
  96556. "I3": [ 3969 ],
  96557. "O": [ 4374 ]
  96558. }
  96559. },
  96560. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I1_SB_LUT4_O": {
  96561. "hide_name": 0,
  96562. "type": "SB_LUT4",
  96563. "parameters": {
  96564. "LUT_INIT": "1111000000000000"
  96565. },
  96566. "attributes": {
  96567. "module_not_derived": "00000000000000000000000000000001",
  96568. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96569. },
  96570. "port_directions": {
  96571. "I0": "input",
  96572. "I1": "input",
  96573. "I2": "input",
  96574. "I3": "input",
  96575. "O": "output"
  96576. },
  96577. "connections": {
  96578. "I0": [ "0" ],
  96579. "I1": [ "0" ],
  96580. "I2": [ 950 ],
  96581. "I3": [ 3969 ],
  96582. "O": [ 4375 ]
  96583. }
  96584. },
  96585. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_I0_SB_LUT4_O": {
  96586. "hide_name": 0,
  96587. "type": "SB_LUT4",
  96588. "parameters": {
  96589. "LUT_INIT": "1111000000000000"
  96590. },
  96591. "attributes": {
  96592. "module_not_derived": "00000000000000000000000000000001",
  96593. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96594. },
  96595. "port_directions": {
  96596. "I0": "input",
  96597. "I1": "input",
  96598. "I2": "input",
  96599. "I3": "input",
  96600. "O": "output"
  96601. },
  96602. "connections": {
  96603. "I0": [ "0" ],
  96604. "I1": [ "0" ],
  96605. "I2": [ 2770 ],
  96606. "I3": [ 3969 ],
  96607. "O": [ 4372 ]
  96608. }
  96609. },
  96610. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_I1_SB_LUT4_O": {
  96611. "hide_name": 0,
  96612. "type": "SB_LUT4",
  96613. "parameters": {
  96614. "LUT_INIT": "1010000010100011"
  96615. },
  96616. "attributes": {
  96617. "module_not_derived": "00000000000000000000000000000001",
  96618. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96619. },
  96620. "port_directions": {
  96621. "I0": "input",
  96622. "I1": "input",
  96623. "I2": "input",
  96624. "I3": "input",
  96625. "O": "output"
  96626. },
  96627. "connections": {
  96628. "I0": [ 948 ],
  96629. "I1": [ 4267 ],
  96630. "I2": [ 3969 ],
  96631. "I3": [ 4376 ],
  96632. "O": [ 4373 ]
  96633. }
  96634. },
  96635. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  96636. "hide_name": 0,
  96637. "type": "SB_LUT4",
  96638. "parameters": {
  96639. "LUT_INIT": "0011001101010011"
  96640. },
  96641. "attributes": {
  96642. "module_not_derived": "00000000000000000000000000000001",
  96643. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96644. },
  96645. "port_directions": {
  96646. "I0": "input",
  96647. "I1": "input",
  96648. "I2": "input",
  96649. "I3": "input",
  96650. "O": "output"
  96651. },
  96652. "connections": {
  96653. "I0": [ 948 ],
  96654. "I1": [ 976 ],
  96655. "I2": [ 3967 ],
  96656. "I3": [ 3968 ],
  96657. "O": [ 4376 ]
  96658. }
  96659. },
  96660. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_24": {
  96661. "hide_name": 0,
  96662. "type": "SB_LUT4",
  96663. "parameters": {
  96664. "LUT_INIT": "0110100110010110"
  96665. },
  96666. "attributes": {
  96667. "module_not_derived": "00000000000000000000000000000001",
  96668. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96669. },
  96670. "port_directions": {
  96671. "I0": "input",
  96672. "I1": "input",
  96673. "I2": "input",
  96674. "I3": "input",
  96675. "O": "output"
  96676. },
  96677. "connections": {
  96678. "I0": [ "0" ],
  96679. "I1": [ 4377 ],
  96680. "I2": [ 4378 ],
  96681. "I3": [ 4379 ],
  96682. "O": [ 4380 ]
  96683. }
  96684. },
  96685. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_24_I1_SB_LUT4_O": {
  96686. "hide_name": 0,
  96687. "type": "SB_LUT4",
  96688. "parameters": {
  96689. "LUT_INIT": "1111000011001100"
  96690. },
  96691. "attributes": {
  96692. "module_not_derived": "00000000000000000000000000000001",
  96693. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96694. },
  96695. "port_directions": {
  96696. "I0": "input",
  96697. "I1": "input",
  96698. "I2": "input",
  96699. "I3": "input",
  96700. "O": "output"
  96701. },
  96702. "connections": {
  96703. "I0": [ "0" ],
  96704. "I1": [ 4260 ],
  96705. "I2": [ 2848 ],
  96706. "I3": [ 3969 ],
  96707. "O": [ 4377 ]
  96708. }
  96709. },
  96710. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_24_I1_SB_LUT4_O_1": {
  96711. "hide_name": 0,
  96712. "type": "SB_LUT4",
  96713. "parameters": {
  96714. "LUT_INIT": "0000000010101100"
  96715. },
  96716. "attributes": {
  96717. "module_not_derived": "00000000000000000000000000000001",
  96718. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96719. },
  96720. "port_directions": {
  96721. "I0": "input",
  96722. "I1": "input",
  96723. "I2": "input",
  96724. "I3": "input",
  96725. "O": "output"
  96726. },
  96727. "connections": {
  96728. "I0": [ 1004 ],
  96729. "I1": [ 972 ],
  96730. "I2": [ 3967 ],
  96731. "I3": [ 4350 ],
  96732. "O": [ 4378 ]
  96733. }
  96734. },
  96735. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_24_I3_SB_CARRY_CO": {
  96736. "hide_name": 0,
  96737. "type": "SB_CARRY",
  96738. "parameters": {
  96739. },
  96740. "attributes": {
  96741. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96742. },
  96743. "port_directions": {
  96744. "CI": "input",
  96745. "CO": "output",
  96746. "I0": "input",
  96747. "I1": "input"
  96748. },
  96749. "connections": {
  96750. "CI": [ 4369 ],
  96751. "CO": [ 4379 ],
  96752. "I0": [ 4367 ],
  96753. "I1": [ 4368 ]
  96754. }
  96755. },
  96756. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_25": {
  96757. "hide_name": 0,
  96758. "type": "SB_LUT4",
  96759. "parameters": {
  96760. "LUT_INIT": "0110100110010110"
  96761. },
  96762. "attributes": {
  96763. "module_not_derived": "00000000000000000000000000000001",
  96764. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96765. },
  96766. "port_directions": {
  96767. "I0": "input",
  96768. "I1": "input",
  96769. "I2": "input",
  96770. "I3": "input",
  96771. "O": "output"
  96772. },
  96773. "connections": {
  96774. "I0": [ "0" ],
  96775. "I1": [ 4381 ],
  96776. "I2": [ 4382 ],
  96777. "I3": [ 4383 ],
  96778. "O": [ 4384 ]
  96779. }
  96780. },
  96781. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_25_I1_SB_LUT4_O": {
  96782. "hide_name": 0,
  96783. "type": "SB_LUT4",
  96784. "parameters": {
  96785. "LUT_INIT": "1100110011110000"
  96786. },
  96787. "attributes": {
  96788. "module_not_derived": "00000000000000000000000000000001",
  96789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96790. },
  96791. "port_directions": {
  96792. "I0": "input",
  96793. "I1": "input",
  96794. "I2": "input",
  96795. "I3": "input",
  96796. "O": "output"
  96797. },
  96798. "connections": {
  96799. "I0": [ "0" ],
  96800. "I1": [ 4120 ],
  96801. "I2": [ 4259 ],
  96802. "I3": [ 3969 ],
  96803. "O": [ 4381 ]
  96804. }
  96805. },
  96806. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_25_I1_SB_LUT4_O_1": {
  96807. "hide_name": 0,
  96808. "type": "SB_LUT4",
  96809. "parameters": {
  96810. "LUT_INIT": "0000000010101100"
  96811. },
  96812. "attributes": {
  96813. "module_not_derived": "00000000000000000000000000000001",
  96814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96815. },
  96816. "port_directions": {
  96817. "I0": "input",
  96818. "I1": "input",
  96819. "I2": "input",
  96820. "I3": "input",
  96821. "O": "output"
  96822. },
  96823. "connections": {
  96824. "I0": [ 1002 ],
  96825. "I1": [ 970 ],
  96826. "I2": [ 3967 ],
  96827. "I3": [ 4350 ],
  96828. "O": [ 4382 ]
  96829. }
  96830. },
  96831. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_25_I3_SB_CARRY_CO": {
  96832. "hide_name": 0,
  96833. "type": "SB_CARRY",
  96834. "parameters": {
  96835. },
  96836. "attributes": {
  96837. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96838. },
  96839. "port_directions": {
  96840. "CI": "input",
  96841. "CO": "output",
  96842. "I0": "input",
  96843. "I1": "input"
  96844. },
  96845. "connections": {
  96846. "CI": [ 4379 ],
  96847. "CO": [ 4383 ],
  96848. "I0": [ 4377 ],
  96849. "I1": [ 4378 ]
  96850. }
  96851. },
  96852. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_26": {
  96853. "hide_name": 0,
  96854. "type": "SB_LUT4",
  96855. "parameters": {
  96856. "LUT_INIT": "0110100110010110"
  96857. },
  96858. "attributes": {
  96859. "module_not_derived": "00000000000000000000000000000001",
  96860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96861. },
  96862. "port_directions": {
  96863. "I0": "input",
  96864. "I1": "input",
  96865. "I2": "input",
  96866. "I3": "input",
  96867. "O": "output"
  96868. },
  96869. "connections": {
  96870. "I0": [ "0" ],
  96871. "I1": [ 4385 ],
  96872. "I2": [ 4386 ],
  96873. "I3": [ 4387 ],
  96874. "O": [ 4388 ]
  96875. }
  96876. },
  96877. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_26_I1_SB_LUT4_O": {
  96878. "hide_name": 0,
  96879. "type": "SB_LUT4",
  96880. "parameters": {
  96881. "LUT_INIT": "1111000011001100"
  96882. },
  96883. "attributes": {
  96884. "module_not_derived": "00000000000000000000000000000001",
  96885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96886. },
  96887. "port_directions": {
  96888. "I0": "input",
  96889. "I1": "input",
  96890. "I2": "input",
  96891. "I3": "input",
  96892. "O": "output"
  96893. },
  96894. "connections": {
  96895. "I0": [ "0" ],
  96896. "I1": [ 3014 ],
  96897. "I2": [ 4115 ],
  96898. "I3": [ 3969 ],
  96899. "O": [ 4385 ]
  96900. }
  96901. },
  96902. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_26_I1_SB_LUT4_O_1": {
  96903. "hide_name": 0,
  96904. "type": "SB_LUT4",
  96905. "parameters": {
  96906. "LUT_INIT": "0000000011110000"
  96907. },
  96908. "attributes": {
  96909. "module_not_derived": "00000000000000000000000000000001",
  96910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  96911. },
  96912. "port_directions": {
  96913. "I0": "input",
  96914. "I1": "input",
  96915. "I2": "input",
  96916. "I3": "input",
  96917. "O": "output"
  96918. },
  96919. "connections": {
  96920. "I0": [ "0" ],
  96921. "I1": [ "0" ],
  96922. "I2": [ 1000 ],
  96923. "I3": [ 4350 ],
  96924. "O": [ 4386 ]
  96925. }
  96926. },
  96927. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_26_I3_SB_CARRY_CO": {
  96928. "hide_name": 0,
  96929. "type": "SB_CARRY",
  96930. "parameters": {
  96931. },
  96932. "attributes": {
  96933. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  96934. },
  96935. "port_directions": {
  96936. "CI": "input",
  96937. "CO": "output",
  96938. "I0": "input",
  96939. "I1": "input"
  96940. },
  96941. "connections": {
  96942. "CI": [ 4383 ],
  96943. "CO": [ 4387 ],
  96944. "I0": [ 4381 ],
  96945. "I1": [ 4382 ]
  96946. }
  96947. },
  96948. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_27": {
  96949. "hide_name": 0,
  96950. "type": "SB_LUT4",
  96951. "parameters": {
  96952. "LUT_INIT": "0110100110010110"
  96953. },
  96954. "attributes": {
  96955. "module_not_derived": "00000000000000000000000000000001",
  96956. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  96957. },
  96958. "port_directions": {
  96959. "I0": "input",
  96960. "I1": "input",
  96961. "I2": "input",
  96962. "I3": "input",
  96963. "O": "output"
  96964. },
  96965. "connections": {
  96966. "I0": [ "0" ],
  96967. "I1": [ 4389 ],
  96968. "I2": [ 4390 ],
  96969. "I3": [ 4391 ],
  96970. "O": [ 4392 ]
  96971. }
  96972. },
  96973. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_27_I1_SB_LUT4_O": {
  96974. "hide_name": 0,
  96975. "type": "SB_LUT4",
  96976. "parameters": {
  96977. "LUT_INIT": "1111000011001100"
  96978. },
  96979. "attributes": {
  96980. "module_not_derived": "00000000000000000000000000000001",
  96981. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  96982. },
  96983. "port_directions": {
  96984. "I0": "input",
  96985. "I1": "input",
  96986. "I2": "input",
  96987. "I3": "input",
  96988. "O": "output"
  96989. },
  96990. "connections": {
  96991. "I0": [ "0" ],
  96992. "I1": [ 3034 ],
  96993. "I2": [ 4110 ],
  96994. "I3": [ 3969 ],
  96995. "O": [ 4389 ]
  96996. }
  96997. },
  96998. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_27_I1_SB_LUT4_O_1": {
  96999. "hide_name": 0,
  97000. "type": "SB_LUT4",
  97001. "parameters": {
  97002. "LUT_INIT": "0000000011110000"
  97003. },
  97004. "attributes": {
  97005. "module_not_derived": "00000000000000000000000000000001",
  97006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  97007. },
  97008. "port_directions": {
  97009. "I0": "input",
  97010. "I1": "input",
  97011. "I2": "input",
  97012. "I3": "input",
  97013. "O": "output"
  97014. },
  97015. "connections": {
  97016. "I0": [ "0" ],
  97017. "I1": [ "0" ],
  97018. "I2": [ 998 ],
  97019. "I3": [ 4350 ],
  97020. "O": [ 4390 ]
  97021. }
  97022. },
  97023. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_27_I3_SB_CARRY_CO": {
  97024. "hide_name": 0,
  97025. "type": "SB_CARRY",
  97026. "parameters": {
  97027. },
  97028. "attributes": {
  97029. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97030. },
  97031. "port_directions": {
  97032. "CI": "input",
  97033. "CO": "output",
  97034. "I0": "input",
  97035. "I1": "input"
  97036. },
  97037. "connections": {
  97038. "CI": [ 4387 ],
  97039. "CO": [ 4391 ],
  97040. "I0": [ 4385 ],
  97041. "I1": [ 4386 ]
  97042. }
  97043. },
  97044. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_28": {
  97045. "hide_name": 0,
  97046. "type": "SB_LUT4",
  97047. "parameters": {
  97048. "LUT_INIT": "0110100110010110"
  97049. },
  97050. "attributes": {
  97051. "module_not_derived": "00000000000000000000000000000001",
  97052. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97053. },
  97054. "port_directions": {
  97055. "I0": "input",
  97056. "I1": "input",
  97057. "I2": "input",
  97058. "I3": "input",
  97059. "O": "output"
  97060. },
  97061. "connections": {
  97062. "I0": [ "0" ],
  97063. "I1": [ 4393 ],
  97064. "I2": [ 4394 ],
  97065. "I3": [ 4395 ],
  97066. "O": [ 4396 ]
  97067. }
  97068. },
  97069. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_28_I1_SB_LUT4_O": {
  97070. "hide_name": 0,
  97071. "type": "SB_LUT4",
  97072. "parameters": {
  97073. "LUT_INIT": "1100110011110000"
  97074. },
  97075. "attributes": {
  97076. "module_not_derived": "00000000000000000000000000000001",
  97077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97078. },
  97079. "port_directions": {
  97080. "I0": "input",
  97081. "I1": "input",
  97082. "I2": "input",
  97083. "I3": "input",
  97084. "O": "output"
  97085. },
  97086. "connections": {
  97087. "I0": [ "0" ],
  97088. "I1": [ 2846 ],
  97089. "I2": [ 3045 ],
  97090. "I3": [ 3969 ],
  97091. "O": [ 4393 ]
  97092. }
  97093. },
  97094. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_28_I1_SB_LUT4_O_1": {
  97095. "hide_name": 0,
  97096. "type": "SB_LUT4",
  97097. "parameters": {
  97098. "LUT_INIT": "0000000011110000"
  97099. },
  97100. "attributes": {
  97101. "module_not_derived": "00000000000000000000000000000001",
  97102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  97103. },
  97104. "port_directions": {
  97105. "I0": "input",
  97106. "I1": "input",
  97107. "I2": "input",
  97108. "I3": "input",
  97109. "O": "output"
  97110. },
  97111. "connections": {
  97112. "I0": [ "0" ],
  97113. "I1": [ "0" ],
  97114. "I2": [ 996 ],
  97115. "I3": [ 4350 ],
  97116. "O": [ 4394 ]
  97117. }
  97118. },
  97119. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_28_I3_SB_CARRY_CO": {
  97120. "hide_name": 0,
  97121. "type": "SB_CARRY",
  97122. "parameters": {
  97123. },
  97124. "attributes": {
  97125. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97126. },
  97127. "port_directions": {
  97128. "CI": "input",
  97129. "CO": "output",
  97130. "I0": "input",
  97131. "I1": "input"
  97132. },
  97133. "connections": {
  97134. "CI": [ 4391 ],
  97135. "CO": [ 4395 ],
  97136. "I0": [ 4389 ],
  97137. "I1": [ 4390 ]
  97138. }
  97139. },
  97140. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_29": {
  97141. "hide_name": 0,
  97142. "type": "SB_LUT4",
  97143. "parameters": {
  97144. "LUT_INIT": "0110100110010110"
  97145. },
  97146. "attributes": {
  97147. "module_not_derived": "00000000000000000000000000000001",
  97148. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97149. },
  97150. "port_directions": {
  97151. "I0": "input",
  97152. "I1": "input",
  97153. "I2": "input",
  97154. "I3": "input",
  97155. "O": "output"
  97156. },
  97157. "connections": {
  97158. "I0": [ "0" ],
  97159. "I1": [ 4353 ],
  97160. "I2": [ 4354 ],
  97161. "I3": [ 4352 ],
  97162. "O": [ 4397 ]
  97163. }
  97164. },
  97165. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_29_I1_SB_LUT4_O": {
  97166. "hide_name": 0,
  97167. "type": "SB_LUT4",
  97168. "parameters": {
  97169. "LUT_INIT": "1111000011001100"
  97170. },
  97171. "attributes": {
  97172. "module_not_derived": "00000000000000000000000000000001",
  97173. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97174. },
  97175. "port_directions": {
  97176. "I0": "input",
  97177. "I1": "input",
  97178. "I2": "input",
  97179. "I3": "input",
  97180. "O": "output"
  97181. },
  97182. "connections": {
  97183. "I0": [ "0" ],
  97184. "I1": [ 3059 ],
  97185. "I2": [ 4099 ],
  97186. "I3": [ 3969 ],
  97187. "O": [ 4353 ]
  97188. }
  97189. },
  97190. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_29_I1_SB_LUT4_O_1": {
  97191. "hide_name": 0,
  97192. "type": "SB_LUT4",
  97193. "parameters": {
  97194. "LUT_INIT": "0000000011110000"
  97195. },
  97196. "attributes": {
  97197. "module_not_derived": "00000000000000000000000000000001",
  97198. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  97199. },
  97200. "port_directions": {
  97201. "I0": "input",
  97202. "I1": "input",
  97203. "I2": "input",
  97204. "I3": "input",
  97205. "O": "output"
  97206. },
  97207. "connections": {
  97208. "I0": [ "0" ],
  97209. "I1": [ "0" ],
  97210. "I2": [ 990 ],
  97211. "I3": [ 4350 ],
  97212. "O": [ 4354 ]
  97213. }
  97214. },
  97215. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_29_I3_SB_CARRY_CO": {
  97216. "hide_name": 0,
  97217. "type": "SB_CARRY",
  97218. "parameters": {
  97219. },
  97220. "attributes": {
  97221. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97222. },
  97223. "port_directions": {
  97224. "CI": "input",
  97225. "CO": "output",
  97226. "I0": "input",
  97227. "I1": "input"
  97228. },
  97229. "connections": {
  97230. "CI": [ 4395 ],
  97231. "CO": [ 4352 ],
  97232. "I0": [ 4393 ],
  97233. "I1": [ 4394 ]
  97234. }
  97235. },
  97236. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_2_I1_SB_LUT4_O": {
  97237. "hide_name": 0,
  97238. "type": "SB_LUT4",
  97239. "parameters": {
  97240. "LUT_INIT": "1111000011001100"
  97241. },
  97242. "attributes": {
  97243. "module_not_derived": "00000000000000000000000000000001",
  97244. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97245. },
  97246. "port_directions": {
  97247. "I0": "input",
  97248. "I1": "input",
  97249. "I2": "input",
  97250. "I3": "input",
  97251. "O": "output"
  97252. },
  97253. "connections": {
  97254. "I0": [ "0" ],
  97255. "I1": [ 3074 ],
  97256. "I2": [ 4098 ],
  97257. "I3": [ 3969 ],
  97258. "O": [ 4355 ]
  97259. }
  97260. },
  97261. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_2_I1_SB_LUT4_O_1": {
  97262. "hide_name": 0,
  97263. "type": "SB_LUT4",
  97264. "parameters": {
  97265. "LUT_INIT": "0000000011110000"
  97266. },
  97267. "attributes": {
  97268. "module_not_derived": "00000000000000000000000000000001",
  97269. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  97270. },
  97271. "port_directions": {
  97272. "I0": "input",
  97273. "I1": "input",
  97274. "I2": "input",
  97275. "I3": "input",
  97276. "O": "output"
  97277. },
  97278. "connections": {
  97279. "I0": [ "0" ],
  97280. "I1": [ "0" ],
  97281. "I2": [ 946 ],
  97282. "I3": [ 4350 ],
  97283. "O": [ 4356 ]
  97284. }
  97285. },
  97286. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  97287. "hide_name": 0,
  97288. "type": "SB_CARRY",
  97289. "parameters": {
  97290. },
  97291. "attributes": {
  97292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97293. },
  97294. "port_directions": {
  97295. "CI": "input",
  97296. "CO": "output",
  97297. "I0": "input",
  97298. "I1": "input"
  97299. },
  97300. "connections": {
  97301. "CI": [ 4311 ],
  97302. "CO": [ 4357 ],
  97303. "I0": [ 4309 ],
  97304. "I1": [ 4310 ]
  97305. }
  97306. },
  97307. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3": {
  97308. "hide_name": 0,
  97309. "type": "SB_LUT4",
  97310. "parameters": {
  97311. "LUT_INIT": "0110100110010110"
  97312. },
  97313. "attributes": {
  97314. "module_not_derived": "00000000000000000000000000000001",
  97315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97316. },
  97317. "port_directions": {
  97318. "I0": "input",
  97319. "I1": "input",
  97320. "I2": "input",
  97321. "I3": "input",
  97322. "O": "output"
  97323. },
  97324. "connections": {
  97325. "I0": [ "0" ],
  97326. "I1": [ 4398 ],
  97327. "I2": [ 4399 ],
  97328. "I3": [ 4400 ],
  97329. "O": [ 4401 ]
  97330. }
  97331. },
  97332. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1_SB_LUT4_O": {
  97333. "hide_name": 0,
  97334. "type": "SB_LUT4",
  97335. "parameters": {
  97336. "LUT_INIT": "1111000011001100"
  97337. },
  97338. "attributes": {
  97339. "module_not_derived": "00000000000000000000000000000001",
  97340. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97341. },
  97342. "port_directions": {
  97343. "I0": "input",
  97344. "I1": "input",
  97345. "I2": "input",
  97346. "I3": "input",
  97347. "O": "output"
  97348. },
  97349. "connections": {
  97350. "I0": [ "0" ],
  97351. "I1": [ 2867 ],
  97352. "I2": [ 2852 ],
  97353. "I3": [ 3969 ],
  97354. "O": [ 4398 ]
  97355. }
  97356. },
  97357. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1_SB_LUT4_O_1": {
  97358. "hide_name": 0,
  97359. "type": "SB_LUT4",
  97360. "parameters": {
  97361. "LUT_INIT": "1111111111000000"
  97362. },
  97363. "attributes": {
  97364. "module_not_derived": "00000000000000000000000000000001",
  97365. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97366. },
  97367. "port_directions": {
  97368. "I0": "input",
  97369. "I1": "input",
  97370. "I2": "input",
  97371. "I3": "input",
  97372. "O": "output"
  97373. },
  97374. "connections": {
  97375. "I0": [ "0" ],
  97376. "I1": [ 943 ],
  97377. "I2": [ 3969 ],
  97378. "I3": [ 4402 ],
  97379. "O": [ 4399 ]
  97380. }
  97381. },
  97382. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  97383. "hide_name": 0,
  97384. "type": "SB_LUT4",
  97385. "parameters": {
  97386. "LUT_INIT": "1111101100000000"
  97387. },
  97388. "attributes": {
  97389. "module_not_derived": "00000000000000000000000000000001",
  97390. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97391. },
  97392. "port_directions": {
  97393. "I0": "input",
  97394. "I1": "input",
  97395. "I2": "input",
  97396. "I3": "input",
  97397. "O": "output"
  97398. },
  97399. "connections": {
  97400. "I0": [ 950 ],
  97401. "I1": [ 3967 ],
  97402. "I2": [ 3968 ],
  97403. "I3": [ 4403 ],
  97404. "O": [ 4402 ]
  97405. }
  97406. },
  97407. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  97408. "hide_name": 0,
  97409. "type": "SB_LUT4",
  97410. "parameters": {
  97411. "LUT_INIT": "0000001000001110"
  97412. },
  97413. "attributes": {
  97414. "module_not_derived": "00000000000000000000000000000001",
  97415. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97416. },
  97417. "port_directions": {
  97418. "I0": "input",
  97419. "I1": "input",
  97420. "I2": "input",
  97421. "I3": "input",
  97422. "O": "output"
  97423. },
  97424. "connections": {
  97425. "I0": [ 978 ],
  97426. "I1": [ 3967 ],
  97427. "I2": [ 4267 ],
  97428. "I3": [ 3968 ],
  97429. "O": [ 4403 ]
  97430. }
  97431. },
  97432. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  97433. "hide_name": 0,
  97434. "type": "SB_CARRY",
  97435. "parameters": {
  97436. },
  97437. "attributes": {
  97438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97439. },
  97440. "port_directions": {
  97441. "CI": "input",
  97442. "CO": "output",
  97443. "I0": "input",
  97444. "I1": "input"
  97445. },
  97446. "connections": {
  97447. "CI": [ 4357 ],
  97448. "CO": [ 4400 ],
  97449. "I0": [ 4355 ],
  97450. "I1": [ 4356 ]
  97451. }
  97452. },
  97453. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4": {
  97454. "hide_name": 0,
  97455. "type": "SB_LUT4",
  97456. "parameters": {
  97457. "LUT_INIT": "0110100110010110"
  97458. },
  97459. "attributes": {
  97460. "module_not_derived": "00000000000000000000000000000001",
  97461. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97462. },
  97463. "port_directions": {
  97464. "I0": "input",
  97465. "I1": "input",
  97466. "I2": "input",
  97467. "I3": "input",
  97468. "O": "output"
  97469. },
  97470. "connections": {
  97471. "I0": [ "0" ],
  97472. "I1": [ 4404 ],
  97473. "I2": [ 4405 ],
  97474. "I3": [ 4406 ],
  97475. "O": [ 4407 ]
  97476. }
  97477. },
  97478. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I1_SB_LUT4_O": {
  97479. "hide_name": 0,
  97480. "type": "SB_LUT4",
  97481. "parameters": {
  97482. "LUT_INIT": "1100110011110000"
  97483. },
  97484. "attributes": {
  97485. "module_not_derived": "00000000000000000000000000000001",
  97486. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97487. },
  97488. "port_directions": {
  97489. "I0": "input",
  97490. "I1": "input",
  97491. "I2": "input",
  97492. "I3": "input",
  97493. "O": "output"
  97494. },
  97495. "connections": {
  97496. "I0": [ "0" ],
  97497. "I1": [ 4089 ],
  97498. "I2": [ 2880 ],
  97499. "I3": [ 3969 ],
  97500. "O": [ 4404 ]
  97501. }
  97502. },
  97503. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I1_SB_LUT4_O_1": {
  97504. "hide_name": 0,
  97505. "type": "SB_LUT4",
  97506. "parameters": {
  97507. "LUT_INIT": "1010000010100011"
  97508. },
  97509. "attributes": {
  97510. "module_not_derived": "00000000000000000000000000000001",
  97511. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97512. },
  97513. "port_directions": {
  97514. "I0": "input",
  97515. "I1": "input",
  97516. "I2": "input",
  97517. "I3": "input",
  97518. "O": "output"
  97519. },
  97520. "connections": {
  97521. "I0": [ 943 ],
  97522. "I1": [ 4267 ],
  97523. "I2": [ 3969 ],
  97524. "I3": [ 4408 ],
  97525. "O": [ 4405 ]
  97526. }
  97527. },
  97528. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  97529. "hide_name": 0,
  97530. "type": "SB_LUT4",
  97531. "parameters": {
  97532. "LUT_INIT": "0101010100110101"
  97533. },
  97534. "attributes": {
  97535. "module_not_derived": "00000000000000000000000000000001",
  97536. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97537. },
  97538. "port_directions": {
  97539. "I0": "input",
  97540. "I1": "input",
  97541. "I2": "input",
  97542. "I3": "input",
  97543. "O": "output"
  97544. },
  97545. "connections": {
  97546. "I0": [ 943 ],
  97547. "I1": [ 966 ],
  97548. "I2": [ 3967 ],
  97549. "I3": [ 3968 ],
  97550. "O": [ 4408 ]
  97551. }
  97552. },
  97553. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  97554. "hide_name": 0,
  97555. "type": "SB_CARRY",
  97556. "parameters": {
  97557. },
  97558. "attributes": {
  97559. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97560. },
  97561. "port_directions": {
  97562. "CI": "input",
  97563. "CO": "output",
  97564. "I0": "input",
  97565. "I1": "input"
  97566. },
  97567. "connections": {
  97568. "CI": [ 4400 ],
  97569. "CO": [ 4406 ],
  97570. "I0": [ 4398 ],
  97571. "I1": [ 4399 ]
  97572. }
  97573. },
  97574. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5": {
  97575. "hide_name": 0,
  97576. "type": "SB_LUT4",
  97577. "parameters": {
  97578. "LUT_INIT": "0110100110010110"
  97579. },
  97580. "attributes": {
  97581. "module_not_derived": "00000000000000000000000000000001",
  97582. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97583. },
  97584. "port_directions": {
  97585. "I0": "input",
  97586. "I1": "input",
  97587. "I2": "input",
  97588. "I3": "input",
  97589. "O": "output"
  97590. },
  97591. "connections": {
  97592. "I0": [ "0" ],
  97593. "I1": [ 4409 ],
  97594. "I2": [ 4410 ],
  97595. "I3": [ 4411 ],
  97596. "O": [ 4412 ]
  97597. }
  97598. },
  97599. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I1_SB_LUT4_O": {
  97600. "hide_name": 0,
  97601. "type": "SB_LUT4",
  97602. "parameters": {
  97603. "LUT_INIT": "1100110011110000"
  97604. },
  97605. "attributes": {
  97606. "module_not_derived": "00000000000000000000000000000001",
  97607. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97608. },
  97609. "port_directions": {
  97610. "I0": "input",
  97611. "I1": "input",
  97612. "I2": "input",
  97613. "I3": "input",
  97614. "O": "output"
  97615. },
  97616. "connections": {
  97617. "I0": [ "0" ],
  97618. "I1": [ 4084 ],
  97619. "I2": [ 4256 ],
  97620. "I3": [ 3969 ],
  97621. "O": [ 4409 ]
  97622. }
  97623. },
  97624. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I1_SB_LUT4_O_1": {
  97625. "hide_name": 0,
  97626. "type": "SB_LUT4",
  97627. "parameters": {
  97628. "LUT_INIT": "1010000010100011"
  97629. },
  97630. "attributes": {
  97631. "module_not_derived": "00000000000000000000000000000001",
  97632. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97633. },
  97634. "port_directions": {
  97635. "I0": "input",
  97636. "I1": "input",
  97637. "I2": "input",
  97638. "I3": "input",
  97639. "O": "output"
  97640. },
  97641. "connections": {
  97642. "I0": [ 943 ],
  97643. "I1": [ 4267 ],
  97644. "I2": [ 3969 ],
  97645. "I3": [ 4413 ],
  97646. "O": [ 4410 ]
  97647. }
  97648. },
  97649. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  97650. "hide_name": 0,
  97651. "type": "SB_LUT4",
  97652. "parameters": {
  97653. "LUT_INIT": "0101010100110101"
  97654. },
  97655. "attributes": {
  97656. "module_not_derived": "00000000000000000000000000000001",
  97657. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97658. },
  97659. "port_directions": {
  97660. "I0": "input",
  97661. "I1": "input",
  97662. "I2": "input",
  97663. "I3": "input",
  97664. "O": "output"
  97665. },
  97666. "connections": {
  97667. "I0": [ 943 ],
  97668. "I1": [ 964 ],
  97669. "I2": [ 3967 ],
  97670. "I3": [ 3968 ],
  97671. "O": [ 4413 ]
  97672. }
  97673. },
  97674. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  97675. "hide_name": 0,
  97676. "type": "SB_CARRY",
  97677. "parameters": {
  97678. },
  97679. "attributes": {
  97680. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97681. },
  97682. "port_directions": {
  97683. "CI": "input",
  97684. "CO": "output",
  97685. "I0": "input",
  97686. "I1": "input"
  97687. },
  97688. "connections": {
  97689. "CI": [ 4406 ],
  97690. "CO": [ 4411 ],
  97691. "I0": [ 4404 ],
  97692. "I1": [ 4405 ]
  97693. }
  97694. },
  97695. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6": {
  97696. "hide_name": 0,
  97697. "type": "SB_LUT4",
  97698. "parameters": {
  97699. "LUT_INIT": "0110100110010110"
  97700. },
  97701. "attributes": {
  97702. "module_not_derived": "00000000000000000000000000000001",
  97703. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97704. },
  97705. "port_directions": {
  97706. "I0": "input",
  97707. "I1": "input",
  97708. "I2": "input",
  97709. "I3": "input",
  97710. "O": "output"
  97711. },
  97712. "connections": {
  97713. "I0": [ "0" ],
  97714. "I1": [ 4414 ],
  97715. "I2": [ 4415 ],
  97716. "I3": [ 4416 ],
  97717. "O": [ 4417 ]
  97718. }
  97719. },
  97720. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I1_SB_LUT4_O": {
  97721. "hide_name": 0,
  97722. "type": "SB_LUT4",
  97723. "parameters": {
  97724. "LUT_INIT": "1111000011001100"
  97725. },
  97726. "attributes": {
  97727. "module_not_derived": "00000000000000000000000000000001",
  97728. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97729. },
  97730. "port_directions": {
  97731. "I0": "input",
  97732. "I1": "input",
  97733. "I2": "input",
  97734. "I3": "input",
  97735. "O": "output"
  97736. },
  97737. "connections": {
  97738. "I0": [ "0" ],
  97739. "I1": [ 2896 ],
  97740. "I2": [ 4079 ],
  97741. "I3": [ 3969 ],
  97742. "O": [ 4414 ]
  97743. }
  97744. },
  97745. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I1_SB_LUT4_O_1": {
  97746. "hide_name": 0,
  97747. "type": "SB_LUT4",
  97748. "parameters": {
  97749. "LUT_INIT": "1010000010100011"
  97750. },
  97751. "attributes": {
  97752. "module_not_derived": "00000000000000000000000000000001",
  97753. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97754. },
  97755. "port_directions": {
  97756. "I0": "input",
  97757. "I1": "input",
  97758. "I2": "input",
  97759. "I3": "input",
  97760. "O": "output"
  97761. },
  97762. "connections": {
  97763. "I0": [ 943 ],
  97764. "I1": [ 4267 ],
  97765. "I2": [ 3969 ],
  97766. "I3": [ 4418 ],
  97767. "O": [ 4415 ]
  97768. }
  97769. },
  97770. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  97771. "hide_name": 0,
  97772. "type": "SB_LUT4",
  97773. "parameters": {
  97774. "LUT_INIT": "0101010100110101"
  97775. },
  97776. "attributes": {
  97777. "module_not_derived": "00000000000000000000000000000001",
  97778. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97779. },
  97780. "port_directions": {
  97781. "I0": "input",
  97782. "I1": "input",
  97783. "I2": "input",
  97784. "I3": "input",
  97785. "O": "output"
  97786. },
  97787. "connections": {
  97788. "I0": [ 943 ],
  97789. "I1": [ 962 ],
  97790. "I2": [ 3967 ],
  97791. "I3": [ 3968 ],
  97792. "O": [ 4418 ]
  97793. }
  97794. },
  97795. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  97796. "hide_name": 0,
  97797. "type": "SB_CARRY",
  97798. "parameters": {
  97799. },
  97800. "attributes": {
  97801. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97802. },
  97803. "port_directions": {
  97804. "CI": "input",
  97805. "CO": "output",
  97806. "I0": "input",
  97807. "I1": "input"
  97808. },
  97809. "connections": {
  97810. "CI": [ 4411 ],
  97811. "CO": [ 4416 ],
  97812. "I0": [ 4409 ],
  97813. "I1": [ 4410 ]
  97814. }
  97815. },
  97816. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7": {
  97817. "hide_name": 0,
  97818. "type": "SB_LUT4",
  97819. "parameters": {
  97820. "LUT_INIT": "0110100110010110"
  97821. },
  97822. "attributes": {
  97823. "module_not_derived": "00000000000000000000000000000001",
  97824. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97825. },
  97826. "port_directions": {
  97827. "I0": "input",
  97828. "I1": "input",
  97829. "I2": "input",
  97830. "I3": "input",
  97831. "O": "output"
  97832. },
  97833. "connections": {
  97834. "I0": [ "0" ],
  97835. "I1": [ 4419 ],
  97836. "I2": [ 4420 ],
  97837. "I3": [ 4421 ],
  97838. "O": [ 4422 ]
  97839. }
  97840. },
  97841. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I1_SB_LUT4_O": {
  97842. "hide_name": 0,
  97843. "type": "SB_LUT4",
  97844. "parameters": {
  97845. "LUT_INIT": "1111000011001100"
  97846. },
  97847. "attributes": {
  97848. "module_not_derived": "00000000000000000000000000000001",
  97849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97850. },
  97851. "port_directions": {
  97852. "I0": "input",
  97853. "I1": "input",
  97854. "I2": "input",
  97855. "I3": "input",
  97856. "O": "output"
  97857. },
  97858. "connections": {
  97859. "I0": [ "0" ],
  97860. "I1": [ 4255 ],
  97861. "I2": [ 4074 ],
  97862. "I3": [ 3969 ],
  97863. "O": [ 4419 ]
  97864. }
  97865. },
  97866. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I1_SB_LUT4_O_1": {
  97867. "hide_name": 0,
  97868. "type": "SB_LUT4",
  97869. "parameters": {
  97870. "LUT_INIT": "1010000010100011"
  97871. },
  97872. "attributes": {
  97873. "module_not_derived": "00000000000000000000000000000001",
  97874. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97875. },
  97876. "port_directions": {
  97877. "I0": "input",
  97878. "I1": "input",
  97879. "I2": "input",
  97880. "I3": "input",
  97881. "O": "output"
  97882. },
  97883. "connections": {
  97884. "I0": [ 943 ],
  97885. "I1": [ 4267 ],
  97886. "I2": [ 3969 ],
  97887. "I3": [ 4423 ],
  97888. "O": [ 4420 ]
  97889. }
  97890. },
  97891. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  97892. "hide_name": 0,
  97893. "type": "SB_LUT4",
  97894. "parameters": {
  97895. "LUT_INIT": "0101010100110101"
  97896. },
  97897. "attributes": {
  97898. "module_not_derived": "00000000000000000000000000000001",
  97899. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97900. },
  97901. "port_directions": {
  97902. "I0": "input",
  97903. "I1": "input",
  97904. "I2": "input",
  97905. "I3": "input",
  97906. "O": "output"
  97907. },
  97908. "connections": {
  97909. "I0": [ 943 ],
  97910. "I1": [ 960 ],
  97911. "I2": [ 3967 ],
  97912. "I3": [ 3968 ],
  97913. "O": [ 4423 ]
  97914. }
  97915. },
  97916. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  97917. "hide_name": 0,
  97918. "type": "SB_CARRY",
  97919. "parameters": {
  97920. },
  97921. "attributes": {
  97922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  97923. },
  97924. "port_directions": {
  97925. "CI": "input",
  97926. "CO": "output",
  97927. "I0": "input",
  97928. "I1": "input"
  97929. },
  97930. "connections": {
  97931. "CI": [ 4416 ],
  97932. "CO": [ 4421 ],
  97933. "I0": [ 4414 ],
  97934. "I1": [ 4415 ]
  97935. }
  97936. },
  97937. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8": {
  97938. "hide_name": 0,
  97939. "type": "SB_LUT4",
  97940. "parameters": {
  97941. "LUT_INIT": "0110100110010110"
  97942. },
  97943. "attributes": {
  97944. "module_not_derived": "00000000000000000000000000000001",
  97945. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97946. },
  97947. "port_directions": {
  97948. "I0": "input",
  97949. "I1": "input",
  97950. "I2": "input",
  97951. "I3": "input",
  97952. "O": "output"
  97953. },
  97954. "connections": {
  97955. "I0": [ "0" ],
  97956. "I1": [ 4424 ],
  97957. "I2": [ 4425 ],
  97958. "I3": [ 4426 ],
  97959. "O": [ 4427 ]
  97960. }
  97961. },
  97962. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I1_SB_LUT4_O": {
  97963. "hide_name": 0,
  97964. "type": "SB_LUT4",
  97965. "parameters": {
  97966. "LUT_INIT": "1111000011001100"
  97967. },
  97968. "attributes": {
  97969. "module_not_derived": "00000000000000000000000000000001",
  97970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  97971. },
  97972. "port_directions": {
  97973. "I0": "input",
  97974. "I1": "input",
  97975. "I2": "input",
  97976. "I3": "input",
  97977. "O": "output"
  97978. },
  97979. "connections": {
  97980. "I0": [ "0" ],
  97981. "I1": [ 2911 ],
  97982. "I2": [ 4069 ],
  97983. "I3": [ 3969 ],
  97984. "O": [ 4424 ]
  97985. }
  97986. },
  97987. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I1_SB_LUT4_O_1": {
  97988. "hide_name": 0,
  97989. "type": "SB_LUT4",
  97990. "parameters": {
  97991. "LUT_INIT": "1010000010100011"
  97992. },
  97993. "attributes": {
  97994. "module_not_derived": "00000000000000000000000000000001",
  97995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  97996. },
  97997. "port_directions": {
  97998. "I0": "input",
  97999. "I1": "input",
  98000. "I2": "input",
  98001. "I3": "input",
  98002. "O": "output"
  98003. },
  98004. "connections": {
  98005. "I0": [ 943 ],
  98006. "I1": [ 4267 ],
  98007. "I2": [ 3969 ],
  98008. "I3": [ 4428 ],
  98009. "O": [ 4425 ]
  98010. }
  98011. },
  98012. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  98013. "hide_name": 0,
  98014. "type": "SB_LUT4",
  98015. "parameters": {
  98016. "LUT_INIT": "0101010100110101"
  98017. },
  98018. "attributes": {
  98019. "module_not_derived": "00000000000000000000000000000001",
  98020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98021. },
  98022. "port_directions": {
  98023. "I0": "input",
  98024. "I1": "input",
  98025. "I2": "input",
  98026. "I3": "input",
  98027. "O": "output"
  98028. },
  98029. "connections": {
  98030. "I0": [ 943 ],
  98031. "I1": [ 958 ],
  98032. "I2": [ 3967 ],
  98033. "I3": [ 3968 ],
  98034. "O": [ 4428 ]
  98035. }
  98036. },
  98037. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  98038. "hide_name": 0,
  98039. "type": "SB_CARRY",
  98040. "parameters": {
  98041. },
  98042. "attributes": {
  98043. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  98044. },
  98045. "port_directions": {
  98046. "CI": "input",
  98047. "CO": "output",
  98048. "I0": "input",
  98049. "I1": "input"
  98050. },
  98051. "connections": {
  98052. "CI": [ 4421 ],
  98053. "CO": [ 4426 ],
  98054. "I0": [ 4419 ],
  98055. "I1": [ 4420 ]
  98056. }
  98057. },
  98058. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9": {
  98059. "hide_name": 0,
  98060. "type": "SB_LUT4",
  98061. "parameters": {
  98062. "LUT_INIT": "0110100110010110"
  98063. },
  98064. "attributes": {
  98065. "module_not_derived": "00000000000000000000000000000001",
  98066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98067. },
  98068. "port_directions": {
  98069. "I0": "input",
  98070. "I1": "input",
  98071. "I2": "input",
  98072. "I3": "input",
  98073. "O": "output"
  98074. },
  98075. "connections": {
  98076. "I0": [ "0" ],
  98077. "I1": [ 4319 ],
  98078. "I2": [ 4320 ],
  98079. "I3": [ 4318 ],
  98080. "O": [ 4429 ]
  98081. }
  98082. },
  98083. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I1_SB_LUT4_O": {
  98084. "hide_name": 0,
  98085. "type": "SB_LUT4",
  98086. "parameters": {
  98087. "LUT_INIT": "1100110011110000"
  98088. },
  98089. "attributes": {
  98090. "module_not_derived": "00000000000000000000000000000001",
  98091. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98092. },
  98093. "port_directions": {
  98094. "I0": "input",
  98095. "I1": "input",
  98096. "I2": "input",
  98097. "I3": "input",
  98098. "O": "output"
  98099. },
  98100. "connections": {
  98101. "I0": [ "0" ],
  98102. "I1": [ 4064 ],
  98103. "I2": [ 4254 ],
  98104. "I3": [ 3969 ],
  98105. "O": [ 4319 ]
  98106. }
  98107. },
  98108. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I1_SB_LUT4_O_1": {
  98109. "hide_name": 0,
  98110. "type": "SB_LUT4",
  98111. "parameters": {
  98112. "LUT_INIT": "1010000010100011"
  98113. },
  98114. "attributes": {
  98115. "module_not_derived": "00000000000000000000000000000001",
  98116. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98117. },
  98118. "port_directions": {
  98119. "I0": "input",
  98120. "I1": "input",
  98121. "I2": "input",
  98122. "I3": "input",
  98123. "O": "output"
  98124. },
  98125. "connections": {
  98126. "I0": [ 943 ],
  98127. "I1": [ 4267 ],
  98128. "I2": [ 3969 ],
  98129. "I3": [ 4430 ],
  98130. "O": [ 4320 ]
  98131. }
  98132. },
  98133. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  98134. "hide_name": 0,
  98135. "type": "SB_LUT4",
  98136. "parameters": {
  98137. "LUT_INIT": "0101010100110101"
  98138. },
  98139. "attributes": {
  98140. "module_not_derived": "00000000000000000000000000000001",
  98141. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98142. },
  98143. "port_directions": {
  98144. "I0": "input",
  98145. "I1": "input",
  98146. "I2": "input",
  98147. "I3": "input",
  98148. "O": "output"
  98149. },
  98150. "connections": {
  98151. "I0": [ 943 ],
  98152. "I1": [ 956 ],
  98153. "I2": [ 3967 ],
  98154. "I3": [ 3968 ],
  98155. "O": [ 4430 ]
  98156. }
  98157. },
  98158. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  98159. "hide_name": 0,
  98160. "type": "SB_CARRY",
  98161. "parameters": {
  98162. },
  98163. "attributes": {
  98164. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  98165. },
  98166. "port_directions": {
  98167. "CI": "input",
  98168. "CO": "output",
  98169. "I0": "input",
  98170. "I1": "input"
  98171. },
  98172. "connections": {
  98173. "CI": [ 4426 ],
  98174. "CO": [ 4318 ],
  98175. "I0": [ 4424 ],
  98176. "I1": [ 4425 ]
  98177. }
  98178. },
  98179. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_I1_SB_LUT4_O": {
  98180. "hide_name": 0,
  98181. "type": "SB_LUT4",
  98182. "parameters": {
  98183. "LUT_INIT": "1100110011110000"
  98184. },
  98185. "attributes": {
  98186. "module_not_derived": "00000000000000000000000000000001",
  98187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98188. },
  98189. "port_directions": {
  98190. "I0": "input",
  98191. "I1": "input",
  98192. "I2": "input",
  98193. "I3": "input",
  98194. "O": "output"
  98195. },
  98196. "connections": {
  98197. "I0": [ "0" ],
  98198. "I1": [ 2843 ],
  98199. "I2": [ 4249 ],
  98200. "I3": [ 3969 ],
  98201. "O": [ 4305 ]
  98202. }
  98203. },
  98204. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_I3_SB_CARRY_CO": {
  98205. "hide_name": 0,
  98206. "type": "SB_CARRY",
  98207. "parameters": {
  98208. },
  98209. "attributes": {
  98210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  98211. },
  98212. "port_directions": {
  98213. "CI": "input",
  98214. "CO": "output",
  98215. "I0": "input",
  98216. "I1": "input"
  98217. },
  98218. "connections": {
  98219. "CI": [ 4365 ],
  98220. "CO": [ 4307 ],
  98221. "I0": [ 4351 ],
  98222. "I1": [ 4306 ]
  98223. }
  98224. },
  98225. "cpu_I.execute_CsrPlugin_csr_1984_SB_DFFE_Q": {
  98226. "hide_name": 0,
  98227. "type": "SB_DFFE",
  98228. "parameters": {
  98229. },
  98230. "attributes": {
  98231. "module_not_derived": "00000000000000000000000000000001",
  98232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  98233. },
  98234. "port_directions": {
  98235. "C": "input",
  98236. "D": "input",
  98237. "E": "input",
  98238. "Q": "output"
  98239. },
  98240. "connections": {
  98241. "C": [ 42 ],
  98242. "D": [ 4431 ],
  98243. "E": [ 2263 ],
  98244. "Q": [ 4432 ]
  98245. }
  98246. },
  98247. "cpu_I.execute_CsrPlugin_csr_1984_SB_DFFE_Q_D_SB_LUT4_O": {
  98248. "hide_name": 0,
  98249. "type": "SB_LUT4",
  98250. "parameters": {
  98251. "LUT_INIT": "0100000000000000"
  98252. },
  98253. "attributes": {
  98254. "module_not_derived": "00000000000000000000000000000001",
  98255. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98256. },
  98257. "port_directions": {
  98258. "I0": "input",
  98259. "I1": "input",
  98260. "I2": "input",
  98261. "I3": "input",
  98262. "O": "output"
  98263. },
  98264. "connections": {
  98265. "I0": [ 1821 ],
  98266. "I1": [ 1528 ],
  98267. "I2": [ 4433 ],
  98268. "I3": [ 4434 ],
  98269. "O": [ 4431 ]
  98270. }
  98271. },
  98272. "cpu_I.execute_CsrPlugin_csr_1984_SB_LUT4_I2": {
  98273. "hide_name": 0,
  98274. "type": "SB_LUT4",
  98275. "parameters": {
  98276. "LUT_INIT": "1111000000000000"
  98277. },
  98278. "attributes": {
  98279. "module_not_derived": "00000000000000000000000000000001",
  98280. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98281. },
  98282. "port_directions": {
  98283. "I0": "input",
  98284. "I1": "input",
  98285. "I2": "input",
  98286. "I3": "input",
  98287. "O": "output"
  98288. },
  98289. "connections": {
  98290. "I0": [ "0" ],
  98291. "I1": [ "0" ],
  98292. "I2": [ 4432 ],
  98293. "I3": [ 1153 ],
  98294. "O": [ 2261 ]
  98295. }
  98296. },
  98297. "cpu_I.execute_CsrPlugin_csr_1984_SB_LUT4_I2_O_SB_DFFR_Q": {
  98298. "hide_name": 0,
  98299. "type": "SB_DFFR",
  98300. "parameters": {
  98301. },
  98302. "attributes": {
  98303. "module_not_derived": "00000000000000000000000000000001",
  98304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  98305. },
  98306. "port_directions": {
  98307. "C": "input",
  98308. "D": "input",
  98309. "Q": "output",
  98310. "R": "input"
  98311. },
  98312. "connections": {
  98313. "C": [ 42 ],
  98314. "D": [ 4435 ],
  98315. "Q": [ 2260 ],
  98316. "R": [ 127 ]
  98317. }
  98318. },
  98319. "cpu_I.execute_CsrPlugin_csr_1984_SB_LUT4_I2_O_SB_DFFR_Q_D_SB_LUT4_O": {
  98320. "hide_name": 0,
  98321. "type": "SB_LUT4",
  98322. "parameters": {
  98323. "LUT_INIT": "1111110000001100"
  98324. },
  98325. "attributes": {
  98326. "module_not_derived": "00000000000000000000000000000001",
  98327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98328. },
  98329. "port_directions": {
  98330. "I0": "input",
  98331. "I1": "input",
  98332. "I2": "input",
  98333. "I3": "input",
  98334. "O": "output"
  98335. },
  98336. "connections": {
  98337. "I0": [ "0" ],
  98338. "I1": [ 2260 ],
  98339. "I2": [ 2261 ],
  98340. "I3": [ 1223 ],
  98341. "O": [ 4435 ]
  98342. }
  98343. },
  98344. "cpu_I.execute_CsrPlugin_csr_3008_SB_DFFE_Q": {
  98345. "hide_name": 0,
  98346. "type": "SB_DFFE",
  98347. "parameters": {
  98348. },
  98349. "attributes": {
  98350. "module_not_derived": "00000000000000000000000000000001",
  98351. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  98352. },
  98353. "port_directions": {
  98354. "C": "input",
  98355. "D": "input",
  98356. "E": "input",
  98357. "Q": "output"
  98358. },
  98359. "connections": {
  98360. "C": [ 42 ],
  98361. "D": [ 4436 ],
  98362. "E": [ 2263 ],
  98363. "Q": [ 1037 ]
  98364. }
  98365. },
  98366. "cpu_I.execute_CsrPlugin_csr_3008_SB_DFFE_Q_D_SB_LUT4_O": {
  98367. "hide_name": 0,
  98368. "type": "SB_LUT4",
  98369. "parameters": {
  98370. "LUT_INIT": "0010000000000000"
  98371. },
  98372. "attributes": {
  98373. "module_not_derived": "00000000000000000000000000000001",
  98374. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98375. },
  98376. "port_directions": {
  98377. "I0": "input",
  98378. "I1": "input",
  98379. "I2": "input",
  98380. "I3": "input",
  98381. "O": "output"
  98382. },
  98383. "connections": {
  98384. "I0": [ 1821 ],
  98385. "I1": [ 1528 ],
  98386. "I2": [ 4433 ],
  98387. "I3": [ 4434 ],
  98388. "O": [ 4436 ]
  98389. }
  98390. },
  98391. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q": {
  98392. "hide_name": 0,
  98393. "type": "SB_DFFE",
  98394. "parameters": {
  98395. },
  98396. "attributes": {
  98397. "module_not_derived": "00000000000000000000000000000001",
  98398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  98399. },
  98400. "port_directions": {
  98401. "C": "input",
  98402. "D": "input",
  98403. "E": "input",
  98404. "Q": "output"
  98405. },
  98406. "connections": {
  98407. "C": [ 42 ],
  98408. "D": [ 4437 ],
  98409. "E": [ 2263 ],
  98410. "Q": [ 1042 ]
  98411. }
  98412. },
  98413. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O": {
  98414. "hide_name": 0,
  98415. "type": "SB_LUT4",
  98416. "parameters": {
  98417. "LUT_INIT": "0100000000000000"
  98418. },
  98419. "attributes": {
  98420. "module_not_derived": "00000000000000000000000000000001",
  98421. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98422. },
  98423. "port_directions": {
  98424. "I0": "input",
  98425. "I1": "input",
  98426. "I2": "input",
  98427. "I3": "input",
  98428. "O": "output"
  98429. },
  98430. "connections": {
  98431. "I0": [ 1547 ],
  98432. "I1": [ 4438 ],
  98433. "I2": [ 4439 ],
  98434. "I3": [ 4440 ],
  98435. "O": [ 4437 ]
  98436. }
  98437. },
  98438. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2": {
  98439. "hide_name": 0,
  98440. "type": "SB_LUT4",
  98441. "parameters": {
  98442. "LUT_INIT": "1111000000000000"
  98443. },
  98444. "attributes": {
  98445. "module_not_derived": "00000000000000000000000000000001",
  98446. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98447. },
  98448. "port_directions": {
  98449. "I0": "input",
  98450. "I1": "input",
  98451. "I2": "input",
  98452. "I3": "input",
  98453. "O": "output"
  98454. },
  98455. "connections": {
  98456. "I0": [ "0" ],
  98457. "I1": [ "0" ],
  98458. "I2": [ 4441 ],
  98459. "I3": [ 4440 ],
  98460. "O": [ 4434 ]
  98461. }
  98462. },
  98463. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_LUT4_I3": {
  98464. "hide_name": 0,
  98465. "type": "SB_LUT4",
  98466. "parameters": {
  98467. "LUT_INIT": "0000001100000000"
  98468. },
  98469. "attributes": {
  98470. "module_not_derived": "00000000000000000000000000000001",
  98471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98472. },
  98473. "port_directions": {
  98474. "I0": "input",
  98475. "I1": "input",
  98476. "I2": "input",
  98477. "I3": "input",
  98478. "O": "output"
  98479. },
  98480. "connections": {
  98481. "I0": [ "0" ],
  98482. "I1": [ 1821 ],
  98483. "I2": [ 1528 ],
  98484. "I3": [ 4433 ],
  98485. "O": [ 4439 ]
  98486. }
  98487. },
  98488. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O": {
  98489. "hide_name": 0,
  98490. "type": "SB_LUT4",
  98491. "parameters": {
  98492. "LUT_INIT": "0000000000000100"
  98493. },
  98494. "attributes": {
  98495. "module_not_derived": "00000000000000000000000000000001",
  98496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98497. },
  98498. "port_directions": {
  98499. "I0": "input",
  98500. "I1": "input",
  98501. "I2": "input",
  98502. "I3": "input",
  98503. "O": "output"
  98504. },
  98505. "connections": {
  98506. "I0": [ 1550 ],
  98507. "I1": [ 1551 ],
  98508. "I2": [ 1552 ],
  98509. "I3": [ 1530 ],
  98510. "O": [ 4442 ]
  98511. }
  98512. },
  98513. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O_1": {
  98514. "hide_name": 0,
  98515. "type": "SB_LUT4",
  98516. "parameters": {
  98517. "LUT_INIT": "0000000000000011"
  98518. },
  98519. "attributes": {
  98520. "module_not_derived": "00000000000000000000000000000001",
  98521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98522. },
  98523. "port_directions": {
  98524. "I0": "input",
  98525. "I1": "input",
  98526. "I2": "input",
  98527. "I3": "input",
  98528. "O": "output"
  98529. },
  98530. "connections": {
  98531. "I0": [ "0" ],
  98532. "I1": [ 1546 ],
  98533. "I2": [ 1548 ],
  98534. "I3": [ 1549 ],
  98535. "O": [ 4438 ]
  98536. }
  98537. },
  98538. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_LUT4_O": {
  98539. "hide_name": 0,
  98540. "type": "SB_LUT4",
  98541. "parameters": {
  98542. "LUT_INIT": "1111000000000000"
  98543. },
  98544. "attributes": {
  98545. "module_not_derived": "00000000000000000000000000000001",
  98546. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98547. },
  98548. "port_directions": {
  98549. "I0": "input",
  98550. "I1": "input",
  98551. "I2": "input",
  98552. "I3": "input",
  98553. "O": "output"
  98554. },
  98555. "connections": {
  98556. "I0": [ "0" ],
  98557. "I1": [ "0" ],
  98558. "I2": [ 1529 ],
  98559. "I3": [ 1540 ],
  98560. "O": [ 4433 ]
  98561. }
  98562. },
  98563. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  98564. "hide_name": 0,
  98565. "type": "SB_LUT4",
  98566. "parameters": {
  98567. "LUT_INIT": "0000000000001000"
  98568. },
  98569. "attributes": {
  98570. "module_not_derived": "00000000000000000000000000000001",
  98571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98572. },
  98573. "port_directions": {
  98574. "I0": "input",
  98575. "I1": "input",
  98576. "I2": "input",
  98577. "I3": "input",
  98578. "O": "output"
  98579. },
  98580. "connections": {
  98581. "I0": [ 1546 ],
  98582. "I1": [ 1547 ],
  98583. "I2": [ 1548 ],
  98584. "I3": [ 1549 ],
  98585. "O": [ 4441 ]
  98586. }
  98587. },
  98588. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_O_1": {
  98589. "hide_name": 0,
  98590. "type": "SB_LUT4",
  98591. "parameters": {
  98592. "LUT_INIT": "0000001100000000"
  98593. },
  98594. "attributes": {
  98595. "module_not_derived": "00000000000000000000000000000001",
  98596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98597. },
  98598. "port_directions": {
  98599. "I0": "input",
  98600. "I1": "input",
  98601. "I2": "input",
  98602. "I3": "input",
  98603. "O": "output"
  98604. },
  98605. "connections": {
  98606. "I0": [ "0" ],
  98607. "I1": [ 1552 ],
  98608. "I2": [ 1530 ],
  98609. "I3": [ 4443 ],
  98610. "O": [ 4440 ]
  98611. }
  98612. },
  98613. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2": {
  98614. "hide_name": 0,
  98615. "type": "SB_LUT4",
  98616. "parameters": {
  98617. "LUT_INIT": "1111000000000000"
  98618. },
  98619. "attributes": {
  98620. "module_not_derived": "00000000000000000000000000000001",
  98621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98622. },
  98623. "port_directions": {
  98624. "I0": "input",
  98625. "I1": "input",
  98626. "I2": "input",
  98627. "I3": "input",
  98628. "O": "output"
  98629. },
  98630. "connections": {
  98631. "I0": [ "0" ],
  98632. "I1": [ "0" ],
  98633. "I2": [ 1042 ],
  98634. "I3": [ 1153 ],
  98635. "O": [ 1047 ]
  98636. }
  98637. },
  98638. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1": {
  98639. "hide_name": 0,
  98640. "type": "SB_LUT4",
  98641. "parameters": {
  98642. "LUT_INIT": "1111000000000000"
  98643. },
  98644. "attributes": {
  98645. "module_not_derived": "00000000000000000000000000000001",
  98646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98647. },
  98648. "port_directions": {
  98649. "I0": "input",
  98650. "I1": "input",
  98651. "I2": "input",
  98652. "I3": "input",
  98653. "O": "output"
  98654. },
  98655. "connections": {
  98656. "I0": [ "0" ],
  98657. "I1": [ "0" ],
  98658. "I2": [ 1042 ],
  98659. "I3": [ 1145 ],
  98660. "O": [ 4444 ]
  98661. }
  98662. },
  98663. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1_O_SB_DFFER_Q": {
  98664. "hide_name": 0,
  98665. "type": "SB_DFFER",
  98666. "parameters": {
  98667. },
  98668. "attributes": {
  98669. "module_not_derived": "00000000000000000000000000000001",
  98670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  98671. },
  98672. "port_directions": {
  98673. "C": "input",
  98674. "D": "input",
  98675. "E": "input",
  98676. "Q": "output",
  98677. "R": "input"
  98678. },
  98679. "connections": {
  98680. "C": [ 42 ],
  98681. "D": [ 1146 ],
  98682. "E": [ 1040 ],
  98683. "Q": [ 4445 ],
  98684. "R": [ 127 ]
  98685. }
  98686. },
  98687. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1_O_SB_LUT4_I1": {
  98688. "hide_name": 0,
  98689. "type": "SB_LUT4",
  98690. "parameters": {
  98691. "LUT_INIT": "0000011100000000"
  98692. },
  98693. "attributes": {
  98694. "module_not_derived": "00000000000000000000000000000001",
  98695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98696. },
  98697. "port_directions": {
  98698. "I0": "input",
  98699. "I1": "input",
  98700. "I2": "input",
  98701. "I3": "input",
  98702. "O": "output"
  98703. },
  98704. "connections": {
  98705. "I0": [ 1037 ],
  98706. "I1": [ 4445 ],
  98707. "I2": [ 4444 ],
  98708. "I3": [ 4446 ],
  98709. "O": [ 2873 ]
  98710. }
  98711. },
  98712. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1_O_SB_LUT4_I1_O_SB_LUT4_O": {
  98713. "hide_name": 0,
  98714. "type": "SB_LUT4",
  98715. "parameters": {
  98716. "LUT_INIT": "0000110000001010"
  98717. },
  98718. "attributes": {
  98719. "module_not_derived": "00000000000000000000000000000001",
  98720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98721. },
  98722. "port_directions": {
  98723. "I0": "input",
  98724. "I1": "input",
  98725. "I2": "input",
  98726. "I3": "input",
  98727. "O": "output"
  98728. },
  98729. "connections": {
  98730. "I0": [ 4089 ],
  98731. "I1": [ 966 ],
  98732. "I2": [ 2757 ],
  98733. "I3": [ 2758 ],
  98734. "O": [ 2522 ]
  98735. }
  98736. },
  98737. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1_O_SB_LUT4_O": {
  98738. "hide_name": 0,
  98739. "type": "SB_LUT4",
  98740. "parameters": {
  98741. "LUT_INIT": "0001001101011111"
  98742. },
  98743. "attributes": {
  98744. "module_not_derived": "00000000000000000000000000000001",
  98745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98746. },
  98747. "port_directions": {
  98748. "I0": "input",
  98749. "I1": "input",
  98750. "I2": "input",
  98751. "I3": "input",
  98752. "O": "output"
  98753. },
  98754. "connections": {
  98755. "I0": [ 1165 ],
  98756. "I1": [ 1086 ],
  98757. "I2": [ 1034 ],
  98758. "I3": [ 1043 ],
  98759. "O": [ 4446 ]
  98760. }
  98761. },
  98762. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_O_SB_LUT4_O": {
  98763. "hide_name": 0,
  98764. "type": "SB_LUT4",
  98765. "parameters": {
  98766. "LUT_INIT": "1100000000000000"
  98767. },
  98768. "attributes": {
  98769. "module_not_derived": "00000000000000000000000000000001",
  98770. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  98771. },
  98772. "port_directions": {
  98773. "I0": "input",
  98774. "I1": "input",
  98775. "I2": "input",
  98776. "I3": "input",
  98777. "O": "output"
  98778. },
  98779. "connections": {
  98780. "I0": [ "0" ],
  98781. "I1": [ 4447 ],
  98782. "I2": [ 4448 ],
  98783. "I3": [ 4449 ],
  98784. "O": [ 1050 ]
  98785. }
  98786. },
  98787. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_O_SB_LUT4_O_1": {
  98788. "hide_name": 0,
  98789. "type": "SB_LUT4",
  98790. "parameters": {
  98791. "LUT_INIT": "0000111100000000"
  98792. },
  98793. "attributes": {
  98794. "module_not_derived": "00000000000000000000000000000001",
  98795. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98796. },
  98797. "port_directions": {
  98798. "I0": "input",
  98799. "I1": "input",
  98800. "I2": "input",
  98801. "I3": "input",
  98802. "O": "output"
  98803. },
  98804. "connections": {
  98805. "I0": [ "0" ],
  98806. "I1": [ "0" ],
  98807. "I2": [ 1145 ],
  98808. "I3": [ 1052 ],
  98809. "O": [ 1147 ]
  98810. }
  98811. },
  98812. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_DFFR_Q": {
  98813. "hide_name": 0,
  98814. "type": "SB_DFFR",
  98815. "parameters": {
  98816. },
  98817. "attributes": {
  98818. "module_not_derived": "00000000000000000000000000000001",
  98819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  98820. },
  98821. "port_directions": {
  98822. "C": "input",
  98823. "D": "input",
  98824. "Q": "output",
  98825. "R": "input"
  98826. },
  98827. "connections": {
  98828. "C": [ 42 ],
  98829. "D": [ 4450 ],
  98830. "Q": [ 4448 ],
  98831. "R": [ 127 ]
  98832. }
  98833. },
  98834. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_DFFR_Q_1": {
  98835. "hide_name": 0,
  98836. "type": "SB_DFFR",
  98837. "parameters": {
  98838. },
  98839. "attributes": {
  98840. "module_not_derived": "00000000000000000000000000000001",
  98841. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  98842. },
  98843. "port_directions": {
  98844. "C": "input",
  98845. "D": "input",
  98846. "Q": "output",
  98847. "R": "input"
  98848. },
  98849. "connections": {
  98850. "C": [ 42 ],
  98851. "D": [ 4451 ],
  98852. "Q": [ 4447 ],
  98853. "R": [ 127 ]
  98854. }
  98855. },
  98856. "cpu_I.execute_CsrPlugin_csr_772_SB_DFFE_Q": {
  98857. "hide_name": 0,
  98858. "type": "SB_DFFE",
  98859. "parameters": {
  98860. },
  98861. "attributes": {
  98862. "module_not_derived": "00000000000000000000000000000001",
  98863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  98864. },
  98865. "port_directions": {
  98866. "C": "input",
  98867. "D": "input",
  98868. "E": "input",
  98869. "Q": "output"
  98870. },
  98871. "connections": {
  98872. "C": [ 42 ],
  98873. "D": [ 4452 ],
  98874. "E": [ 2263 ],
  98875. "Q": [ 1035 ]
  98876. }
  98877. },
  98878. "cpu_I.execute_CsrPlugin_csr_772_SB_DFFE_Q_D_SB_LUT4_O": {
  98879. "hide_name": 0,
  98880. "type": "SB_LUT4",
  98881. "parameters": {
  98882. "LUT_INIT": "0100000000000000"
  98883. },
  98884. "attributes": {
  98885. "module_not_derived": "00000000000000000000000000000001",
  98886. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98887. },
  98888. "port_directions": {
  98889. "I0": "input",
  98890. "I1": "input",
  98891. "I2": "input",
  98892. "I3": "input",
  98893. "O": "output"
  98894. },
  98895. "connections": {
  98896. "I0": [ 1547 ],
  98897. "I1": [ 4438 ],
  98898. "I2": [ 4442 ],
  98899. "I3": [ 4439 ],
  98900. "O": [ 4452 ]
  98901. }
  98902. },
  98903. "cpu_I.execute_CsrPlugin_csr_773_SB_DFFE_Q": {
  98904. "hide_name": 0,
  98905. "type": "SB_DFFE",
  98906. "parameters": {
  98907. },
  98908. "attributes": {
  98909. "module_not_derived": "00000000000000000000000000000001",
  98910. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  98911. },
  98912. "port_directions": {
  98913. "C": "input",
  98914. "D": "input",
  98915. "E": "input",
  98916. "Q": "output"
  98917. },
  98918. "connections": {
  98919. "C": [ 42 ],
  98920. "D": [ 4453 ],
  98921. "E": [ 2263 ],
  98922. "Q": [ 4454 ]
  98923. }
  98924. },
  98925. "cpu_I.execute_CsrPlugin_csr_773_SB_DFFE_Q_D_SB_LUT4_O": {
  98926. "hide_name": 0,
  98927. "type": "SB_LUT4",
  98928. "parameters": {
  98929. "LUT_INIT": "0100000000000000"
  98930. },
  98931. "attributes": {
  98932. "module_not_derived": "00000000000000000000000000000001",
  98933. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98934. },
  98935. "port_directions": {
  98936. "I0": "input",
  98937. "I1": "input",
  98938. "I2": "input",
  98939. "I3": "input",
  98940. "O": "output"
  98941. },
  98942. "connections": {
  98943. "I0": [ 1547 ],
  98944. "I1": [ 4438 ],
  98945. "I2": [ 4455 ],
  98946. "I3": [ 4439 ],
  98947. "O": [ 4453 ]
  98948. }
  98949. },
  98950. "cpu_I.execute_CsrPlugin_csr_773_SB_DFFE_Q_D_SB_LUT4_O_I2_SB_LUT4_O": {
  98951. "hide_name": 0,
  98952. "type": "SB_LUT4",
  98953. "parameters": {
  98954. "LUT_INIT": "0000010000000000"
  98955. },
  98956. "attributes": {
  98957. "module_not_derived": "00000000000000000000000000000001",
  98958. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  98959. },
  98960. "port_directions": {
  98961. "I0": "input",
  98962. "I1": "input",
  98963. "I2": "input",
  98964. "I3": "input",
  98965. "O": "output"
  98966. },
  98967. "connections": {
  98968. "I0": [ 1550 ],
  98969. "I1": [ 1551 ],
  98970. "I2": [ 1552 ],
  98971. "I3": [ 1530 ],
  98972. "O": [ 4455 ]
  98973. }
  98974. },
  98975. "cpu_I.execute_CsrPlugin_csr_773_SB_LUT4_I2": {
  98976. "hide_name": 0,
  98977. "type": "SB_LUT4",
  98978. "parameters": {
  98979. "LUT_INIT": "1111000000000000"
  98980. },
  98981. "attributes": {
  98982. "module_not_derived": "00000000000000000000000000000001",
  98983. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  98984. },
  98985. "port_directions": {
  98986. "I0": "input",
  98987. "I1": "input",
  98988. "I2": "input",
  98989. "I3": "input",
  98990. "O": "output"
  98991. },
  98992. "connections": {
  98993. "I0": [ "0" ],
  98994. "I1": [ "0" ],
  98995. "I2": [ 4454 ],
  98996. "I3": [ 1153 ],
  98997. "O": [ 1183 ]
  98998. }
  98999. },
  99000. "cpu_I.execute_CsrPlugin_csr_833_SB_DFFE_Q": {
  99001. "hide_name": 0,
  99002. "type": "SB_DFFE",
  99003. "parameters": {
  99004. },
  99005. "attributes": {
  99006. "module_not_derived": "00000000000000000000000000000001",
  99007. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  99008. },
  99009. "port_directions": {
  99010. "C": "input",
  99011. "D": "input",
  99012. "E": "input",
  99013. "Q": "output"
  99014. },
  99015. "connections": {
  99016. "C": [ 42 ],
  99017. "D": [ 4456 ],
  99018. "E": [ 2263 ],
  99019. "Q": [ 1043 ]
  99020. }
  99021. },
  99022. "cpu_I.execute_CsrPlugin_csr_833_SB_DFFE_Q_D_SB_LUT4_O": {
  99023. "hide_name": 0,
  99024. "type": "SB_LUT4",
  99025. "parameters": {
  99026. "LUT_INIT": "0100000000000000"
  99027. },
  99028. "attributes": {
  99029. "module_not_derived": "00000000000000000000000000000001",
  99030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99031. },
  99032. "port_directions": {
  99033. "I0": "input",
  99034. "I1": "input",
  99035. "I2": "input",
  99036. "I3": "input",
  99037. "O": "output"
  99038. },
  99039. "connections": {
  99040. "I0": [ 1552 ],
  99041. "I1": [ 1530 ],
  99042. "I2": [ 4443 ],
  99043. "I3": [ 4457 ],
  99044. "O": [ 4456 ]
  99045. }
  99046. },
  99047. "cpu_I.execute_CsrPlugin_csr_833_SB_DFFE_Q_D_SB_LUT4_O_I2_SB_LUT4_O": {
  99048. "hide_name": 0,
  99049. "type": "SB_LUT4",
  99050. "parameters": {
  99051. "LUT_INIT": "0000000000001111"
  99052. },
  99053. "attributes": {
  99054. "module_not_derived": "00000000000000000000000000000001",
  99055. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  99056. },
  99057. "port_directions": {
  99058. "I0": "input",
  99059. "I1": "input",
  99060. "I2": "input",
  99061. "I3": "input",
  99062. "O": "output"
  99063. },
  99064. "connections": {
  99065. "I0": [ "0" ],
  99066. "I1": [ "0" ],
  99067. "I2": [ 1550 ],
  99068. "I3": [ 1551 ],
  99069. "O": [ 4443 ]
  99070. }
  99071. },
  99072. "cpu_I.execute_CsrPlugin_csr_834_SB_DFFE_Q": {
  99073. "hide_name": 0,
  99074. "type": "SB_DFFE",
  99075. "parameters": {
  99076. },
  99077. "attributes": {
  99078. "module_not_derived": "00000000000000000000000000000001",
  99079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  99080. },
  99081. "port_directions": {
  99082. "C": "input",
  99083. "D": "input",
  99084. "E": "input",
  99085. "Q": "output"
  99086. },
  99087. "connections": {
  99088. "C": [ 42 ],
  99089. "D": [ 4458 ],
  99090. "E": [ 2263 ],
  99091. "Q": [ 1029 ]
  99092. }
  99093. },
  99094. "cpu_I.execute_CsrPlugin_csr_834_SB_DFFE_Q_D_SB_LUT4_O": {
  99095. "hide_name": 0,
  99096. "type": "SB_LUT4",
  99097. "parameters": {
  99098. "LUT_INIT": "0010000000000000"
  99099. },
  99100. "attributes": {
  99101. "module_not_derived": "00000000000000000000000000000001",
  99102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99103. },
  99104. "port_directions": {
  99105. "I0": "input",
  99106. "I1": "input",
  99107. "I2": "input",
  99108. "I3": "input",
  99109. "O": "output"
  99110. },
  99111. "connections": {
  99112. "I0": [ 1552 ],
  99113. "I1": [ 1530 ],
  99114. "I2": [ 4443 ],
  99115. "I3": [ 4457 ],
  99116. "O": [ 4458 ]
  99117. }
  99118. },
  99119. "cpu_I.execute_CsrPlugin_csr_835_SB_DFFE_Q": {
  99120. "hide_name": 0,
  99121. "type": "SB_DFFE",
  99122. "parameters": {
  99123. },
  99124. "attributes": {
  99125. "module_not_derived": "00000000000000000000000000000001",
  99126. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  99127. },
  99128. "port_directions": {
  99129. "C": "input",
  99130. "D": "input",
  99131. "E": "input",
  99132. "Q": "output"
  99133. },
  99134. "connections": {
  99135. "C": [ 42 ],
  99136. "D": [ 4459 ],
  99137. "E": [ 2263 ],
  99138. "Q": [ 1034 ]
  99139. }
  99140. },
  99141. "cpu_I.execute_CsrPlugin_csr_835_SB_DFFE_Q_D_SB_LUT4_O": {
  99142. "hide_name": 0,
  99143. "type": "SB_LUT4",
  99144. "parameters": {
  99145. "LUT_INIT": "1000000000000000"
  99146. },
  99147. "attributes": {
  99148. "module_not_derived": "00000000000000000000000000000001",
  99149. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99150. },
  99151. "port_directions": {
  99152. "I0": "input",
  99153. "I1": "input",
  99154. "I2": "input",
  99155. "I3": "input",
  99156. "O": "output"
  99157. },
  99158. "connections": {
  99159. "I0": [ 1552 ],
  99160. "I1": [ 1530 ],
  99161. "I2": [ 4443 ],
  99162. "I3": [ 4457 ],
  99163. "O": [ 4459 ]
  99164. }
  99165. },
  99166. "cpu_I.execute_CsrPlugin_csr_836_SB_DFFE_Q": {
  99167. "hide_name": 0,
  99168. "type": "SB_DFFE",
  99169. "parameters": {
  99170. },
  99171. "attributes": {
  99172. "module_not_derived": "00000000000000000000000000000001",
  99173. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  99174. },
  99175. "port_directions": {
  99176. "C": "input",
  99177. "D": "input",
  99178. "E": "input",
  99179. "Q": "output"
  99180. },
  99181. "connections": {
  99182. "C": [ 42 ],
  99183. "D": [ 4460 ],
  99184. "E": [ 2263 ],
  99185. "Q": [ 1128 ]
  99186. }
  99187. },
  99188. "cpu_I.execute_CsrPlugin_csr_836_SB_DFFE_Q_D_SB_LUT4_O": {
  99189. "hide_name": 0,
  99190. "type": "SB_LUT4",
  99191. "parameters": {
  99192. "LUT_INIT": "1111000000000000"
  99193. },
  99194. "attributes": {
  99195. "module_not_derived": "00000000000000000000000000000001",
  99196. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  99197. },
  99198. "port_directions": {
  99199. "I0": "input",
  99200. "I1": "input",
  99201. "I2": "input",
  99202. "I3": "input",
  99203. "O": "output"
  99204. },
  99205. "connections": {
  99206. "I0": [ "0" ],
  99207. "I1": [ "0" ],
  99208. "I2": [ 4442 ],
  99209. "I3": [ 4457 ],
  99210. "O": [ 4460 ]
  99211. }
  99212. },
  99213. "cpu_I.execute_CsrPlugin_csr_836_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  99214. "hide_name": 0,
  99215. "type": "SB_LUT4",
  99216. "parameters": {
  99217. "LUT_INIT": "1100000000000000"
  99218. },
  99219. "attributes": {
  99220. "module_not_derived": "00000000000000000000000000000001",
  99221. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  99222. },
  99223. "port_directions": {
  99224. "I0": "input",
  99225. "I1": "input",
  99226. "I2": "input",
  99227. "I3": "input",
  99228. "O": "output"
  99229. },
  99230. "connections": {
  99231. "I0": [ "0" ],
  99232. "I1": [ 1547 ],
  99233. "I2": [ 4438 ],
  99234. "I3": [ 4439 ],
  99235. "O": [ 4457 ]
  99236. }
  99237. },
  99238. "cpu_I.execute_CsrPlugin_csr_836_SB_LUT4_I2": {
  99239. "hide_name": 0,
  99240. "type": "SB_LUT4",
  99241. "parameters": {
  99242. "LUT_INIT": "0000111111111111"
  99243. },
  99244. "attributes": {
  99245. "module_not_derived": "00000000000000000000000000000001",
  99246. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  99247. },
  99248. "port_directions": {
  99249. "I0": "input",
  99250. "I1": "input",
  99251. "I2": "input",
  99252. "I3": "input",
  99253. "O": "output"
  99254. },
  99255. "connections": {
  99256. "I0": [ "0" ],
  99257. "I1": [ "0" ],
  99258. "I2": [ 1128 ],
  99259. "I3": [ 1153 ],
  99260. "O": [ 1127 ]
  99261. }
  99262. },
  99263. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O": {
  99264. "hide_name": 0,
  99265. "type": "SB_LUT4",
  99266. "parameters": {
  99267. "LUT_INIT": "0111000001111010"
  99268. },
  99269. "attributes": {
  99270. "module_not_derived": "00000000000000000000000000000001",
  99271. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99272. },
  99273. "port_directions": {
  99274. "I0": "input",
  99275. "I1": "input",
  99276. "I2": "input",
  99277. "I3": "input",
  99278. "O": "output"
  99279. },
  99280. "connections": {
  99281. "I0": [ 964 ],
  99282. "I1": [ 966 ],
  99283. "I2": [ 2395 ],
  99284. "I3": [ 3062 ],
  99285. "O": [ 1211 ]
  99286. }
  99287. },
  99288. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_1": {
  99289. "hide_name": 0,
  99290. "type": "SB_LUT4",
  99291. "parameters": {
  99292. "LUT_INIT": "0111000001111010"
  99293. },
  99294. "attributes": {
  99295. "module_not_derived": "00000000000000000000000000000001",
  99296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99297. },
  99298. "port_directions": {
  99299. "I0": "input",
  99300. "I1": "input",
  99301. "I2": "input",
  99302. "I3": "input",
  99303. "O": "output"
  99304. },
  99305. "connections": {
  99306. "I0": [ 964 ],
  99307. "I1": [ 966 ],
  99308. "I2": [ 2393 ],
  99309. "I3": [ 3048 ],
  99310. "O": [ 1213 ]
  99311. }
  99312. },
  99313. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_10": {
  99314. "hide_name": 0,
  99315. "type": "SB_LUT4",
  99316. "parameters": {
  99317. "LUT_INIT": "0111000001111010"
  99318. },
  99319. "attributes": {
  99320. "module_not_derived": "00000000000000000000000000000001",
  99321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99322. },
  99323. "port_directions": {
  99324. "I0": "input",
  99325. "I1": "input",
  99326. "I2": "input",
  99327. "I3": "input",
  99328. "O": "output"
  99329. },
  99330. "connections": {
  99331. "I0": [ 964 ],
  99332. "I1": [ 966 ],
  99333. "I2": [ 2382 ],
  99334. "I3": [ 2961 ],
  99335. "O": [ 1229 ]
  99336. }
  99337. },
  99338. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_11": {
  99339. "hide_name": 0,
  99340. "type": "SB_LUT4",
  99341. "parameters": {
  99342. "LUT_INIT": "0111000001111010"
  99343. },
  99344. "attributes": {
  99345. "module_not_derived": "00000000000000000000000000000001",
  99346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99347. },
  99348. "port_directions": {
  99349. "I0": "input",
  99350. "I1": "input",
  99351. "I2": "input",
  99352. "I3": "input",
  99353. "O": "output"
  99354. },
  99355. "connections": {
  99356. "I0": [ 964 ],
  99357. "I1": [ 966 ],
  99358. "I2": [ 2384 ],
  99359. "I3": [ 2958 ],
  99360. "O": [ 1231 ]
  99361. }
  99362. },
  99363. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_12": {
  99364. "hide_name": 0,
  99365. "type": "SB_LUT4",
  99366. "parameters": {
  99367. "LUT_INIT": "0111000001111010"
  99368. },
  99369. "attributes": {
  99370. "module_not_derived": "00000000000000000000000000000001",
  99371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99372. },
  99373. "port_directions": {
  99374. "I0": "input",
  99375. "I1": "input",
  99376. "I2": "input",
  99377. "I3": "input",
  99378. "O": "output"
  99379. },
  99380. "connections": {
  99381. "I0": [ 964 ],
  99382. "I1": [ 966 ],
  99383. "I2": [ 2386 ],
  99384. "I3": [ 2955 ],
  99385. "O": [ 1233 ]
  99386. }
  99387. },
  99388. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_13": {
  99389. "hide_name": 0,
  99390. "type": "SB_LUT4",
  99391. "parameters": {
  99392. "LUT_INIT": "0111000001111010"
  99393. },
  99394. "attributes": {
  99395. "module_not_derived": "00000000000000000000000000000001",
  99396. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99397. },
  99398. "port_directions": {
  99399. "I0": "input",
  99400. "I1": "input",
  99401. "I2": "input",
  99402. "I3": "input",
  99403. "O": "output"
  99404. },
  99405. "connections": {
  99406. "I0": [ 964 ],
  99407. "I1": [ 966 ],
  99408. "I2": [ 2392 ],
  99409. "I3": [ 2943 ],
  99410. "O": [ 1235 ]
  99411. }
  99412. },
  99413. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_14": {
  99414. "hide_name": 0,
  99415. "type": "SB_LUT4",
  99416. "parameters": {
  99417. "LUT_INIT": "0111000001111010"
  99418. },
  99419. "attributes": {
  99420. "module_not_derived": "00000000000000000000000000000001",
  99421. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99422. },
  99423. "port_directions": {
  99424. "I0": "input",
  99425. "I1": "input",
  99426. "I2": "input",
  99427. "I3": "input",
  99428. "O": "output"
  99429. },
  99430. "connections": {
  99431. "I0": [ 964 ],
  99432. "I1": [ 966 ],
  99433. "I2": [ 2394 ],
  99434. "I3": [ 2940 ],
  99435. "O": [ 1237 ]
  99436. }
  99437. },
  99438. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_15": {
  99439. "hide_name": 0,
  99440. "type": "SB_LUT4",
  99441. "parameters": {
  99442. "LUT_INIT": "0111000001111010"
  99443. },
  99444. "attributes": {
  99445. "module_not_derived": "00000000000000000000000000000001",
  99446. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99447. },
  99448. "port_directions": {
  99449. "I0": "input",
  99450. "I1": "input",
  99451. "I2": "input",
  99452. "I3": "input",
  99453. "O": "output"
  99454. },
  99455. "connections": {
  99456. "I0": [ 964 ],
  99457. "I1": [ 966 ],
  99458. "I2": [ 2396 ],
  99459. "I3": [ 2937 ],
  99460. "O": [ 1187 ]
  99461. }
  99462. },
  99463. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_16": {
  99464. "hide_name": 0,
  99465. "type": "SB_LUT4",
  99466. "parameters": {
  99467. "LUT_INIT": "0111000001111010"
  99468. },
  99469. "attributes": {
  99470. "module_not_derived": "00000000000000000000000000000001",
  99471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99472. },
  99473. "port_directions": {
  99474. "I0": "input",
  99475. "I1": "input",
  99476. "I2": "input",
  99477. "I3": "input",
  99478. "O": "output"
  99479. },
  99480. "connections": {
  99481. "I0": [ 964 ],
  99482. "I1": [ 966 ],
  99483. "I2": [ 2398 ],
  99484. "I3": [ 2923 ],
  99485. "O": [ 1189 ]
  99486. }
  99487. },
  99488. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_17": {
  99489. "hide_name": 0,
  99490. "type": "SB_LUT4",
  99491. "parameters": {
  99492. "LUT_INIT": "0111000001111010"
  99493. },
  99494. "attributes": {
  99495. "module_not_derived": "00000000000000000000000000000001",
  99496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99497. },
  99498. "port_directions": {
  99499. "I0": "input",
  99500. "I1": "input",
  99501. "I2": "input",
  99502. "I3": "input",
  99503. "O": "output"
  99504. },
  99505. "connections": {
  99506. "I0": [ 964 ],
  99507. "I1": [ 966 ],
  99508. "I2": [ 2521 ],
  99509. "I3": [ 2920 ],
  99510. "O": [ 1191 ]
  99511. }
  99512. },
  99513. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_18": {
  99514. "hide_name": 0,
  99515. "type": "SB_LUT4",
  99516. "parameters": {
  99517. "LUT_INIT": "0111000001111010"
  99518. },
  99519. "attributes": {
  99520. "module_not_derived": "00000000000000000000000000000001",
  99521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99522. },
  99523. "port_directions": {
  99524. "I0": "input",
  99525. "I1": "input",
  99526. "I2": "input",
  99527. "I3": "input",
  99528. "O": "output"
  99529. },
  99530. "connections": {
  99531. "I0": [ 964 ],
  99532. "I1": [ 966 ],
  99533. "I2": [ 2523 ],
  99534. "I3": [ 2917 ],
  99535. "O": [ 1193 ]
  99536. }
  99537. },
  99538. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_19": {
  99539. "hide_name": 0,
  99540. "type": "SB_LUT4",
  99541. "parameters": {
  99542. "LUT_INIT": "0111000001111010"
  99543. },
  99544. "attributes": {
  99545. "module_not_derived": "00000000000000000000000000000001",
  99546. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99547. },
  99548. "port_directions": {
  99549. "I0": "input",
  99550. "I1": "input",
  99551. "I2": "input",
  99552. "I3": "input",
  99553. "O": "output"
  99554. },
  99555. "connections": {
  99556. "I0": [ 964 ],
  99557. "I1": [ 966 ],
  99558. "I2": [ 2525 ],
  99559. "I3": [ 2914 ],
  99560. "O": [ 1195 ]
  99561. }
  99562. },
  99563. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_2": {
  99564. "hide_name": 0,
  99565. "type": "SB_LUT4",
  99566. "parameters": {
  99567. "LUT_INIT": "0111000001111010"
  99568. },
  99569. "attributes": {
  99570. "module_not_derived": "00000000000000000000000000000001",
  99571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99572. },
  99573. "port_directions": {
  99574. "I0": "input",
  99575. "I1": "input",
  99576. "I2": "input",
  99577. "I3": "input",
  99578. "O": "output"
  99579. },
  99580. "connections": {
  99581. "I0": [ 964 ],
  99582. "I1": [ 966 ],
  99583. "I2": [ 2385 ],
  99584. "I3": [ 3023 ],
  99585. "O": [ 1216 ]
  99586. }
  99587. },
  99588. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_20": {
  99589. "hide_name": 0,
  99590. "type": "SB_LUT4",
  99591. "parameters": {
  99592. "LUT_INIT": "0111000001111010"
  99593. },
  99594. "attributes": {
  99595. "module_not_derived": "00000000000000000000000000000001",
  99596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99597. },
  99598. "port_directions": {
  99599. "I0": "input",
  99600. "I1": "input",
  99601. "I2": "input",
  99602. "I3": "input",
  99603. "O": "output"
  99604. },
  99605. "connections": {
  99606. "I0": [ 964 ],
  99607. "I1": [ 966 ],
  99608. "I2": [ 2527 ],
  99609. "I3": [ 2902 ],
  99610. "O": [ 1197 ]
  99611. }
  99612. },
  99613. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_21": {
  99614. "hide_name": 0,
  99615. "type": "SB_LUT4",
  99616. "parameters": {
  99617. "LUT_INIT": "0111000001111010"
  99618. },
  99619. "attributes": {
  99620. "module_not_derived": "00000000000000000000000000000001",
  99621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99622. },
  99623. "port_directions": {
  99624. "I0": "input",
  99625. "I1": "input",
  99626. "I2": "input",
  99627. "I3": "input",
  99628. "O": "output"
  99629. },
  99630. "connections": {
  99631. "I0": [ 964 ],
  99632. "I1": [ 966 ],
  99633. "I2": [ 2528 ],
  99634. "I3": [ 2899 ],
  99635. "O": [ 1199 ]
  99636. }
  99637. },
  99638. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_22": {
  99639. "hide_name": 0,
  99640. "type": "SB_LUT4",
  99641. "parameters": {
  99642. "LUT_INIT": "0111000001111010"
  99643. },
  99644. "attributes": {
  99645. "module_not_derived": "00000000000000000000000000000001",
  99646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99647. },
  99648. "port_directions": {
  99649. "I0": "input",
  99650. "I1": "input",
  99651. "I2": "input",
  99652. "I3": "input",
  99653. "O": "output"
  99654. },
  99655. "connections": {
  99656. "I0": [ 964 ],
  99657. "I1": [ 966 ],
  99658. "I2": [ 2526 ],
  99659. "I3": [ 2886 ],
  99660. "O": [ 1201 ]
  99661. }
  99662. },
  99663. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_23": {
  99664. "hide_name": 0,
  99665. "type": "SB_LUT4",
  99666. "parameters": {
  99667. "LUT_INIT": "0111000001111010"
  99668. },
  99669. "attributes": {
  99670. "module_not_derived": "00000000000000000000000000000001",
  99671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99672. },
  99673. "port_directions": {
  99674. "I0": "input",
  99675. "I1": "input",
  99676. "I2": "input",
  99677. "I3": "input",
  99678. "O": "output"
  99679. },
  99680. "connections": {
  99681. "I0": [ 964 ],
  99682. "I1": [ 966 ],
  99683. "I2": [ 2524 ],
  99684. "I3": [ 2883 ],
  99685. "O": [ 1203 ]
  99686. }
  99687. },
  99688. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_24": {
  99689. "hide_name": 0,
  99690. "type": "SB_LUT4",
  99691. "parameters": {
  99692. "LUT_INIT": "0111000001111010"
  99693. },
  99694. "attributes": {
  99695. "module_not_derived": "00000000000000000000000000000001",
  99696. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99697. },
  99698. "port_directions": {
  99699. "I0": "input",
  99700. "I1": "input",
  99701. "I2": "input",
  99702. "I3": "input",
  99703. "O": "output"
  99704. },
  99705. "connections": {
  99706. "I0": [ 964 ],
  99707. "I1": [ 966 ],
  99708. "I2": [ 2522 ],
  99709. "I3": [ 2873 ],
  99710. "O": [ 1146 ]
  99711. }
  99712. },
  99713. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_25": {
  99714. "hide_name": 0,
  99715. "type": "SB_LUT4",
  99716. "parameters": {
  99717. "LUT_INIT": "0111000001111010"
  99718. },
  99719. "attributes": {
  99720. "module_not_derived": "00000000000000000000000000000001",
  99721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99722. },
  99723. "port_directions": {
  99724. "I0": "input",
  99725. "I1": "input",
  99726. "I2": "input",
  99727. "I3": "input",
  99728. "O": "output"
  99729. },
  99730. "connections": {
  99731. "I0": [ 964 ],
  99732. "I1": [ 966 ],
  99733. "I2": [ 2397 ],
  99734. "I3": [ 3065 ],
  99735. "O": [ 1209 ]
  99736. }
  99737. },
  99738. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_3": {
  99739. "hide_name": 0,
  99740. "type": "SB_LUT4",
  99741. "parameters": {
  99742. "LUT_INIT": "0111000001111010"
  99743. },
  99744. "attributes": {
  99745. "module_not_derived": "00000000000000000000000000000001",
  99746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99747. },
  99748. "port_directions": {
  99749. "I0": "input",
  99750. "I1": "input",
  99751. "I2": "input",
  99752. "I3": "input",
  99753. "O": "output"
  99754. },
  99755. "connections": {
  99756. "I0": [ 964 ],
  99757. "I1": [ 966 ],
  99758. "I2": [ 2383 ],
  99759. "I3": [ 3001 ],
  99760. "O": [ 1218 ]
  99761. }
  99762. },
  99763. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_4": {
  99764. "hide_name": 0,
  99765. "type": "SB_LUT4",
  99766. "parameters": {
  99767. "LUT_INIT": "0111000001111010"
  99768. },
  99769. "attributes": {
  99770. "module_not_derived": "00000000000000000000000000000001",
  99771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99772. },
  99773. "port_directions": {
  99774. "I0": "input",
  99775. "I1": "input",
  99776. "I2": "input",
  99777. "I3": "input",
  99778. "O": "output"
  99779. },
  99780. "connections": {
  99781. "I0": [ 964 ],
  99782. "I1": [ 966 ],
  99783. "I2": [ 2380 ],
  99784. "I3": [ 2974 ],
  99785. "O": [ 1220 ]
  99786. }
  99787. },
  99788. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_5": {
  99789. "hide_name": 0,
  99790. "type": "SB_LUT4",
  99791. "parameters": {
  99792. "LUT_INIT": "0111000001111010"
  99793. },
  99794. "attributes": {
  99795. "module_not_derived": "00000000000000000000000000000001",
  99796. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99797. },
  99798. "port_directions": {
  99799. "I0": "input",
  99800. "I1": "input",
  99801. "I2": "input",
  99802. "I3": "input",
  99803. "O": "output"
  99804. },
  99805. "connections": {
  99806. "I0": [ 964 ],
  99807. "I1": [ 966 ],
  99808. "I2": [ 1251 ],
  99809. "I3": [ 1253 ],
  99810. "O": [ 1059 ]
  99811. }
  99812. },
  99813. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_6": {
  99814. "hide_name": 0,
  99815. "type": "SB_LUT4",
  99816. "parameters": {
  99817. "LUT_INIT": "0111000001111010"
  99818. },
  99819. "attributes": {
  99820. "module_not_derived": "00000000000000000000000000000001",
  99821. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99822. },
  99823. "port_directions": {
  99824. "I0": "input",
  99825. "I1": "input",
  99826. "I2": "input",
  99827. "I3": "input",
  99828. "O": "output"
  99829. },
  99830. "connections": {
  99831. "I0": [ 964 ],
  99832. "I1": [ 966 ],
  99833. "I2": [ 2469 ],
  99834. "I3": [ 2967 ],
  99835. "O": [ 1185 ]
  99836. }
  99837. },
  99838. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_7": {
  99839. "hide_name": 0,
  99840. "type": "SB_LUT4",
  99841. "parameters": {
  99842. "LUT_INIT": "0111000001111010"
  99843. },
  99844. "attributes": {
  99845. "module_not_derived": "00000000000000000000000000000001",
  99846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99847. },
  99848. "port_directions": {
  99849. "I0": "input",
  99850. "I1": "input",
  99851. "I2": "input",
  99852. "I3": "input",
  99853. "O": "output"
  99854. },
  99855. "connections": {
  99856. "I0": [ 964 ],
  99857. "I1": [ 966 ],
  99858. "I2": [ 2473 ],
  99859. "I3": [ 2977 ],
  99860. "O": [ 1206 ]
  99861. }
  99862. },
  99863. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_8": {
  99864. "hide_name": 0,
  99865. "type": "SB_LUT4",
  99866. "parameters": {
  99867. "LUT_INIT": "0111000001111010"
  99868. },
  99869. "attributes": {
  99870. "module_not_derived": "00000000000000000000000000000001",
  99871. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99872. },
  99873. "port_directions": {
  99874. "I0": "input",
  99875. "I1": "input",
  99876. "I2": "input",
  99877. "I3": "input",
  99878. "O": "output"
  99879. },
  99880. "connections": {
  99881. "I0": [ 964 ],
  99882. "I1": [ 966 ],
  99883. "I2": [ 2471 ],
  99884. "I3": [ 2981 ],
  99885. "O": [ 1225 ]
  99886. }
  99887. },
  99888. "cpu_I.execute_CsrPlugin_writeData_SB_LUT4_O_9": {
  99889. "hide_name": 0,
  99890. "type": "SB_LUT4",
  99891. "parameters": {
  99892. "LUT_INIT": "0111000001111010"
  99893. },
  99894. "attributes": {
  99895. "module_not_derived": "00000000000000000000000000000001",
  99896. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99897. },
  99898. "port_directions": {
  99899. "I0": "input",
  99900. "I1": "input",
  99901. "I2": "input",
  99902. "I3": "input",
  99903. "O": "output"
  99904. },
  99905. "connections": {
  99906. "I0": [ 964 ],
  99907. "I1": [ 966 ],
  99908. "I2": [ 2379 ],
  99909. "I3": [ 2964 ],
  99910. "O": [ 1227 ]
  99911. }
  99912. },
  99913. "cpu_I.execute_MUL_HH_SB_LUT4_O": {
  99914. "hide_name": 0,
  99915. "type": "SB_LUT4",
  99916. "parameters": {
  99917. "LUT_INIT": "0110100110010110"
  99918. },
  99919. "attributes": {
  99920. "module_not_derived": "00000000000000000000000000000001",
  99921. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99922. },
  99923. "port_directions": {
  99924. "I0": "input",
  99925. "I1": "input",
  99926. "I2": "input",
  99927. "I3": "input",
  99928. "O": "output"
  99929. },
  99930. "connections": {
  99931. "I0": [ "0" ],
  99932. "I1": [ 4461 ],
  99933. "I2": [ 4462 ],
  99934. "I3": [ 4463 ],
  99935. "O": [ 4464 ]
  99936. }
  99937. },
  99938. "cpu_I.execute_MUL_HH_SB_LUT4_O_1": {
  99939. "hide_name": 0,
  99940. "type": "SB_LUT4",
  99941. "parameters": {
  99942. "LUT_INIT": "0110100110010110"
  99943. },
  99944. "attributes": {
  99945. "module_not_derived": "00000000000000000000000000000001",
  99946. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99947. },
  99948. "port_directions": {
  99949. "I0": "input",
  99950. "I1": "input",
  99951. "I2": "input",
  99952. "I3": "input",
  99953. "O": "output"
  99954. },
  99955. "connections": {
  99956. "I0": [ "0" ],
  99957. "I1": [ 4465 ],
  99958. "I2": [ 4466 ],
  99959. "I3": [ 4467 ],
  99960. "O": [ 4468 ]
  99961. }
  99962. },
  99963. "cpu_I.execute_MUL_HH_SB_LUT4_O_10": {
  99964. "hide_name": 0,
  99965. "type": "SB_LUT4",
  99966. "parameters": {
  99967. "LUT_INIT": "0110100110010110"
  99968. },
  99969. "attributes": {
  99970. "module_not_derived": "00000000000000000000000000000001",
  99971. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  99972. },
  99973. "port_directions": {
  99974. "I0": "input",
  99975. "I1": "input",
  99976. "I2": "input",
  99977. "I3": "input",
  99978. "O": "output"
  99979. },
  99980. "connections": {
  99981. "I0": [ "0" ],
  99982. "I1": [ 4469 ],
  99983. "I2": [ 4470 ],
  99984. "I3": [ 4471 ],
  99985. "O": [ 4472 ]
  99986. }
  99987. },
  99988. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O": {
  99989. "hide_name": 0,
  99990. "type": "SB_LUT4",
  99991. "parameters": {
  99992. "LUT_INIT": "1111110011000000"
  99993. },
  99994. "attributes": {
  99995. "module_not_derived": "00000000000000000000000000000001",
  99996. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  99997. },
  99998. "port_directions": {
  99999. "I0": "input",
  100000. "I1": "input",
  100001. "I2": "input",
  100002. "I3": "input",
  100003. "O": "output"
  100004. },
  100005. "connections": {
  100006. "I0": [ "0" ],
  100007. "I1": [ 4473 ],
  100008. "I2": [ 4474 ],
  100009. "I3": [ 4475 ],
  100010. "O": [ 4470 ]
  100011. }
  100012. },
  100013. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O_1": {
  100014. "hide_name": 0,
  100015. "type": "SB_LUT4",
  100016. "parameters": {
  100017. "LUT_INIT": "1100001100111100"
  100018. },
  100019. "attributes": {
  100020. "module_not_derived": "00000000000000000000000000000001",
  100021. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100022. },
  100023. "port_directions": {
  100024. "I0": "input",
  100025. "I1": "input",
  100026. "I2": "input",
  100027. "I3": "input",
  100028. "O": "output"
  100029. },
  100030. "connections": {
  100031. "I0": [ "0" ],
  100032. "I1": [ 4476 ],
  100033. "I2": [ 4477 ],
  100034. "I3": [ 4478 ],
  100035. "O": [ 4469 ]
  100036. }
  100037. },
  100038. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  100039. "hide_name": 0,
  100040. "type": "SB_LUT4",
  100041. "parameters": {
  100042. "LUT_INIT": "0110100110010110"
  100043. },
  100044. "attributes": {
  100045. "module_not_derived": "00000000000000000000000000000001",
  100046. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100047. },
  100048. "port_directions": {
  100049. "I0": "input",
  100050. "I1": "input",
  100051. "I2": "input",
  100052. "I3": "input",
  100053. "O": "output"
  100054. },
  100055. "connections": {
  100056. "I0": [ "0" ],
  100057. "I1": [ 4479 ],
  100058. "I2": [ "0" ],
  100059. "I3": [ 4480 ],
  100060. "O": [ 4475 ]
  100061. }
  100062. },
  100063. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O_I2_SB_LUT4_O_1": {
  100064. "hide_name": 0,
  100065. "type": "SB_LUT4",
  100066. "parameters": {
  100067. "LUT_INIT": "0110100110010110"
  100068. },
  100069. "attributes": {
  100070. "module_not_derived": "00000000000000000000000000000001",
  100071. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100072. },
  100073. "port_directions": {
  100074. "I0": "input",
  100075. "I1": "input",
  100076. "I2": "input",
  100077. "I3": "input",
  100078. "O": "output"
  100079. },
  100080. "connections": {
  100081. "I0": [ "0" ],
  100082. "I1": [ 4481 ],
  100083. "I2": [ "0" ],
  100084. "I3": [ 4482 ],
  100085. "O": [ 4474 ]
  100086. }
  100087. },
  100088. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  100089. "hide_name": 0,
  100090. "type": "SB_LUT4",
  100091. "parameters": {
  100092. "LUT_INIT": "0000111100000000"
  100093. },
  100094. "attributes": {
  100095. "module_not_derived": "00000000000000000000000000000001",
  100096. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100097. },
  100098. "port_directions": {
  100099. "I0": "input",
  100100. "I1": "input",
  100101. "I2": "input",
  100102. "I3": "input",
  100103. "O": "output"
  100104. },
  100105. "connections": {
  100106. "I0": [ "0" ],
  100107. "I1": [ "0" ],
  100108. "I2": [ 4054 ],
  100109. "I3": [ 4303 ],
  100110. "O": [ 4479 ]
  100111. }
  100112. },
  100113. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  100114. "hide_name": 0,
  100115. "type": "SB_CARRY",
  100116. "parameters": {
  100117. },
  100118. "attributes": {
  100119. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100120. },
  100121. "port_directions": {
  100122. "CI": "input",
  100123. "CO": "output",
  100124. "I0": "input",
  100125. "I1": "input"
  100126. },
  100127. "connections": {
  100128. "CI": [ 4483 ],
  100129. "CO": [ 4471 ],
  100130. "I0": [ 4484 ],
  100131. "I1": [ 4485 ]
  100132. }
  100133. },
  100134. "cpu_I.execute_MUL_HH_SB_LUT4_O_11": {
  100135. "hide_name": 0,
  100136. "type": "SB_LUT4",
  100137. "parameters": {
  100138. "LUT_INIT": "0110100110010110"
  100139. },
  100140. "attributes": {
  100141. "module_not_derived": "00000000000000000000000000000001",
  100142. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100143. },
  100144. "port_directions": {
  100145. "I0": "input",
  100146. "I1": "input",
  100147. "I2": "input",
  100148. "I3": "input",
  100149. "O": "output"
  100150. },
  100151. "connections": {
  100152. "I0": [ "0" ],
  100153. "I1": [ 4486 ],
  100154. "I2": [ 4487 ],
  100155. "I3": [ 4488 ],
  100156. "O": [ 4489 ]
  100157. }
  100158. },
  100159. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I1_SB_LUT4_O": {
  100160. "hide_name": 0,
  100161. "type": "SB_LUT4",
  100162. "parameters": {
  100163. "LUT_INIT": "1111110011000000"
  100164. },
  100165. "attributes": {
  100166. "module_not_derived": "00000000000000000000000000000001",
  100167. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100168. },
  100169. "port_directions": {
  100170. "I0": "input",
  100171. "I1": "input",
  100172. "I2": "input",
  100173. "I3": "input",
  100174. "O": "output"
  100175. },
  100176. "connections": {
  100177. "I0": [ "0" ],
  100178. "I1": [ 4476 ],
  100179. "I2": [ 4477 ],
  100180. "I3": [ 4478 ],
  100181. "O": [ 4487 ]
  100182. }
  100183. },
  100184. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I1_SB_LUT4_O_1": {
  100185. "hide_name": 0,
  100186. "type": "SB_LUT4",
  100187. "parameters": {
  100188. "LUT_INIT": "1100001100111100"
  100189. },
  100190. "attributes": {
  100191. "module_not_derived": "00000000000000000000000000000001",
  100192. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100193. },
  100194. "port_directions": {
  100195. "I0": "input",
  100196. "I1": "input",
  100197. "I2": "input",
  100198. "I3": "input",
  100199. "O": "output"
  100200. },
  100201. "connections": {
  100202. "I0": [ "0" ],
  100203. "I1": [ 4490 ],
  100204. "I2": [ 4491 ],
  100205. "I3": [ 4492 ],
  100206. "O": [ 4486 ]
  100207. }
  100208. },
  100209. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I1_SB_LUT4_O_I2_SB_LUT4_O": {
  100210. "hide_name": 0,
  100211. "type": "SB_LUT4",
  100212. "parameters": {
  100213. "LUT_INIT": "0110100110010110"
  100214. },
  100215. "attributes": {
  100216. "module_not_derived": "00000000000000000000000000000001",
  100217. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100218. },
  100219. "port_directions": {
  100220. "I0": "input",
  100221. "I1": "input",
  100222. "I2": "input",
  100223. "I3": "input",
  100224. "O": "output"
  100225. },
  100226. "connections": {
  100227. "I0": [ "0" ],
  100228. "I1": [ 4493 ],
  100229. "I2": [ "0" ],
  100230. "I3": [ 4494 ],
  100231. "O": [ 4478 ]
  100232. }
  100233. },
  100234. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  100235. "hide_name": 0,
  100236. "type": "SB_CARRY",
  100237. "parameters": {
  100238. },
  100239. "attributes": {
  100240. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100241. },
  100242. "port_directions": {
  100243. "CI": "input",
  100244. "CO": "output",
  100245. "I0": "input",
  100246. "I1": "input"
  100247. },
  100248. "connections": {
  100249. "CI": [ 4471 ],
  100250. "CO": [ 4488 ],
  100251. "I0": [ 4469 ],
  100252. "I1": [ 4470 ]
  100253. }
  100254. },
  100255. "cpu_I.execute_MUL_HH_SB_LUT4_O_12": {
  100256. "hide_name": 0,
  100257. "type": "SB_LUT4",
  100258. "parameters": {
  100259. "LUT_INIT": "0110100110010110"
  100260. },
  100261. "attributes": {
  100262. "module_not_derived": "00000000000000000000000000000001",
  100263. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100264. },
  100265. "port_directions": {
  100266. "I0": "input",
  100267. "I1": "input",
  100268. "I2": "input",
  100269. "I3": "input",
  100270. "O": "output"
  100271. },
  100272. "connections": {
  100273. "I0": [ "0" ],
  100274. "I1": [ 4495 ],
  100275. "I2": [ 4496 ],
  100276. "I3": [ 4497 ],
  100277. "O": [ 4498 ]
  100278. }
  100279. },
  100280. "cpu_I.execute_MUL_HH_SB_LUT4_O_12_I1_SB_LUT4_O": {
  100281. "hide_name": 0,
  100282. "type": "SB_LUT4",
  100283. "parameters": {
  100284. "LUT_INIT": "1111110011000000"
  100285. },
  100286. "attributes": {
  100287. "module_not_derived": "00000000000000000000000000000001",
  100288. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100289. },
  100290. "port_directions": {
  100291. "I0": "input",
  100292. "I1": "input",
  100293. "I2": "input",
  100294. "I3": "input",
  100295. "O": "output"
  100296. },
  100297. "connections": {
  100298. "I0": [ "0" ],
  100299. "I1": [ 4490 ],
  100300. "I2": [ 4491 ],
  100301. "I3": [ 4492 ],
  100302. "O": [ 4496 ]
  100303. }
  100304. },
  100305. "cpu_I.execute_MUL_HH_SB_LUT4_O_12_I1_SB_LUT4_O_1": {
  100306. "hide_name": 0,
  100307. "type": "SB_LUT4",
  100308. "parameters": {
  100309. "LUT_INIT": "1100001100111100"
  100310. },
  100311. "attributes": {
  100312. "module_not_derived": "00000000000000000000000000000001",
  100313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100314. },
  100315. "port_directions": {
  100316. "I0": "input",
  100317. "I1": "input",
  100318. "I2": "input",
  100319. "I3": "input",
  100320. "O": "output"
  100321. },
  100322. "connections": {
  100323. "I0": [ "0" ],
  100324. "I1": [ 4499 ],
  100325. "I2": [ 4500 ],
  100326. "I3": [ 4501 ],
  100327. "O": [ 4495 ]
  100328. }
  100329. },
  100330. "cpu_I.execute_MUL_HH_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  100331. "hide_name": 0,
  100332. "type": "SB_CARRY",
  100333. "parameters": {
  100334. },
  100335. "attributes": {
  100336. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100337. },
  100338. "port_directions": {
  100339. "CI": "input",
  100340. "CO": "output",
  100341. "I0": "input",
  100342. "I1": "input"
  100343. },
  100344. "connections": {
  100345. "CI": [ 4488 ],
  100346. "CO": [ 4497 ],
  100347. "I0": [ 4486 ],
  100348. "I1": [ 4487 ]
  100349. }
  100350. },
  100351. "cpu_I.execute_MUL_HH_SB_LUT4_O_13": {
  100352. "hide_name": 0,
  100353. "type": "SB_LUT4",
  100354. "parameters": {
  100355. "LUT_INIT": "0110100110010110"
  100356. },
  100357. "attributes": {
  100358. "module_not_derived": "00000000000000000000000000000001",
  100359. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100360. },
  100361. "port_directions": {
  100362. "I0": "input",
  100363. "I1": "input",
  100364. "I2": "input",
  100365. "I3": "input",
  100366. "O": "output"
  100367. },
  100368. "connections": {
  100369. "I0": [ "0" ],
  100370. "I1": [ 4502 ],
  100371. "I2": [ 4503 ],
  100372. "I3": [ 4504 ],
  100373. "O": [ 4505 ]
  100374. }
  100375. },
  100376. "cpu_I.execute_MUL_HH_SB_LUT4_O_13_I1_SB_LUT4_O": {
  100377. "hide_name": 0,
  100378. "type": "SB_LUT4",
  100379. "parameters": {
  100380. "LUT_INIT": "1111110011000000"
  100381. },
  100382. "attributes": {
  100383. "module_not_derived": "00000000000000000000000000000001",
  100384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100385. },
  100386. "port_directions": {
  100387. "I0": "input",
  100388. "I1": "input",
  100389. "I2": "input",
  100390. "I3": "input",
  100391. "O": "output"
  100392. },
  100393. "connections": {
  100394. "I0": [ "0" ],
  100395. "I1": [ 4499 ],
  100396. "I2": [ 4500 ],
  100397. "I3": [ 4501 ],
  100398. "O": [ 4503 ]
  100399. }
  100400. },
  100401. "cpu_I.execute_MUL_HH_SB_LUT4_O_13_I1_SB_LUT4_O_1": {
  100402. "hide_name": 0,
  100403. "type": "SB_LUT4",
  100404. "parameters": {
  100405. "LUT_INIT": "1100001100111100"
  100406. },
  100407. "attributes": {
  100408. "module_not_derived": "00000000000000000000000000000001",
  100409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100410. },
  100411. "port_directions": {
  100412. "I0": "input",
  100413. "I1": "input",
  100414. "I2": "input",
  100415. "I3": "input",
  100416. "O": "output"
  100417. },
  100418. "connections": {
  100419. "I0": [ "0" ],
  100420. "I1": [ 4506 ],
  100421. "I2": [ 4507 ],
  100422. "I3": [ 4508 ],
  100423. "O": [ 4502 ]
  100424. }
  100425. },
  100426. "cpu_I.execute_MUL_HH_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  100427. "hide_name": 0,
  100428. "type": "SB_CARRY",
  100429. "parameters": {
  100430. },
  100431. "attributes": {
  100432. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100433. },
  100434. "port_directions": {
  100435. "CI": "input",
  100436. "CO": "output",
  100437. "I0": "input",
  100438. "I1": "input"
  100439. },
  100440. "connections": {
  100441. "CI": [ 4497 ],
  100442. "CO": [ 4504 ],
  100443. "I0": [ 4495 ],
  100444. "I1": [ 4496 ]
  100445. }
  100446. },
  100447. "cpu_I.execute_MUL_HH_SB_LUT4_O_14": {
  100448. "hide_name": 0,
  100449. "type": "SB_LUT4",
  100450. "parameters": {
  100451. "LUT_INIT": "0110100110010110"
  100452. },
  100453. "attributes": {
  100454. "module_not_derived": "00000000000000000000000000000001",
  100455. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100456. },
  100457. "port_directions": {
  100458. "I0": "input",
  100459. "I1": "input",
  100460. "I2": "input",
  100461. "I3": "input",
  100462. "O": "output"
  100463. },
  100464. "connections": {
  100465. "I0": [ "0" ],
  100466. "I1": [ 4509 ],
  100467. "I2": [ 4510 ],
  100468. "I3": [ 4511 ],
  100469. "O": [ 4512 ]
  100470. }
  100471. },
  100472. "cpu_I.execute_MUL_HH_SB_LUT4_O_14_I1_SB_LUT4_O": {
  100473. "hide_name": 0,
  100474. "type": "SB_LUT4",
  100475. "parameters": {
  100476. "LUT_INIT": "1111110011000000"
  100477. },
  100478. "attributes": {
  100479. "module_not_derived": "00000000000000000000000000000001",
  100480. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100481. },
  100482. "port_directions": {
  100483. "I0": "input",
  100484. "I1": "input",
  100485. "I2": "input",
  100486. "I3": "input",
  100487. "O": "output"
  100488. },
  100489. "connections": {
  100490. "I0": [ "0" ],
  100491. "I1": [ 4506 ],
  100492. "I2": [ 4507 ],
  100493. "I3": [ 4508 ],
  100494. "O": [ 4510 ]
  100495. }
  100496. },
  100497. "cpu_I.execute_MUL_HH_SB_LUT4_O_14_I1_SB_LUT4_O_1": {
  100498. "hide_name": 0,
  100499. "type": "SB_LUT4",
  100500. "parameters": {
  100501. "LUT_INIT": "1100001100111100"
  100502. },
  100503. "attributes": {
  100504. "module_not_derived": "00000000000000000000000000000001",
  100505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100506. },
  100507. "port_directions": {
  100508. "I0": "input",
  100509. "I1": "input",
  100510. "I2": "input",
  100511. "I3": "input",
  100512. "O": "output"
  100513. },
  100514. "connections": {
  100515. "I0": [ "0" ],
  100516. "I1": [ 4513 ],
  100517. "I2": [ 4514 ],
  100518. "I3": [ 4515 ],
  100519. "O": [ 4509 ]
  100520. }
  100521. },
  100522. "cpu_I.execute_MUL_HH_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  100523. "hide_name": 0,
  100524. "type": "SB_CARRY",
  100525. "parameters": {
  100526. },
  100527. "attributes": {
  100528. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100529. },
  100530. "port_directions": {
  100531. "CI": "input",
  100532. "CO": "output",
  100533. "I0": "input",
  100534. "I1": "input"
  100535. },
  100536. "connections": {
  100537. "CI": [ 4504 ],
  100538. "CO": [ 4511 ],
  100539. "I0": [ 4502 ],
  100540. "I1": [ 4503 ]
  100541. }
  100542. },
  100543. "cpu_I.execute_MUL_HH_SB_LUT4_O_15": {
  100544. "hide_name": 0,
  100545. "type": "SB_LUT4",
  100546. "parameters": {
  100547. "LUT_INIT": "1100001100111100"
  100548. },
  100549. "attributes": {
  100550. "module_not_derived": "00000000000000000000000000000001",
  100551. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  100552. },
  100553. "port_directions": {
  100554. "I0": "input",
  100555. "I1": "input",
  100556. "I2": "input",
  100557. "I3": "input",
  100558. "O": "output"
  100559. },
  100560. "connections": {
  100561. "I0": [ "0" ],
  100562. "I1": [ 4516 ],
  100563. "I2": [ 4517 ],
  100564. "I3": [ 4518 ],
  100565. "O": [ 4519 ]
  100566. }
  100567. },
  100568. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O": {
  100569. "hide_name": 0,
  100570. "type": "SB_LUT4",
  100571. "parameters": {
  100572. "LUT_INIT": "0110100110010110"
  100573. },
  100574. "attributes": {
  100575. "module_not_derived": "00000000000000000000000000000001",
  100576. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100577. },
  100578. "port_directions": {
  100579. "I0": "input",
  100580. "I1": "input",
  100581. "I2": "input",
  100582. "I3": "input",
  100583. "O": "output"
  100584. },
  100585. "connections": {
  100586. "I0": [ "0" ],
  100587. "I1": [ 4303 ],
  100588. "I2": [ 4520 ],
  100589. "I3": [ "0" ],
  100590. "O": [ 4518 ]
  100591. }
  100592. },
  100593. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1": {
  100594. "hide_name": 0,
  100595. "type": "SB_LUT4",
  100596. "parameters": {
  100597. "LUT_INIT": "0110100110010110"
  100598. },
  100599. "attributes": {
  100600. "module_not_derived": "00000000000000000000000000000001",
  100601. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100602. },
  100603. "port_directions": {
  100604. "I0": "input",
  100605. "I1": "input",
  100606. "I2": "input",
  100607. "I3": "input",
  100608. "O": "output"
  100609. },
  100610. "connections": {
  100611. "I0": [ "0" ],
  100612. "I1": [ 4521 ],
  100613. "I2": [ 4522 ],
  100614. "I3": [ "0" ],
  100615. "O": [ 4517 ]
  100616. }
  100617. },
  100618. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1": {
  100619. "hide_name": 0,
  100620. "type": "SB_CARRY",
  100621. "parameters": {
  100622. },
  100623. "attributes": {
  100624. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100625. },
  100626. "port_directions": {
  100627. "CI": "input",
  100628. "CO": "output",
  100629. "I0": "input",
  100630. "I1": "input"
  100631. },
  100632. "connections": {
  100633. "CI": [ "0" ],
  100634. "CO": [ 4523 ],
  100635. "I0": [ 4521 ],
  100636. "I1": [ 4522 ]
  100637. }
  100638. },
  100639. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_CARRY_CI": {
  100640. "hide_name": 0,
  100641. "type": "SB_CARRY",
  100642. "parameters": {
  100643. },
  100644. "attributes": {
  100645. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100646. },
  100647. "port_directions": {
  100648. "CI": "input",
  100649. "CO": "output",
  100650. "I0": "input",
  100651. "I1": "input"
  100652. },
  100653. "connections": {
  100654. "CI": [ 4523 ],
  100655. "CO": [ 4524 ],
  100656. "I0": [ 4525 ],
  100657. "I1": [ "0" ]
  100658. }
  100659. },
  100660. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_CARRY_CI": {
  100661. "hide_name": 0,
  100662. "type": "SB_CARRY",
  100663. "parameters": {
  100664. },
  100665. "attributes": {
  100666. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100667. },
  100668. "port_directions": {
  100669. "CI": "input",
  100670. "CO": "output",
  100671. "I0": "input",
  100672. "I1": "input"
  100673. },
  100674. "connections": {
  100675. "CI": [ 4524 ],
  100676. "CO": [ 4482 ],
  100677. "I0": [ 4526 ],
  100678. "I1": [ "0" ]
  100679. }
  100680. },
  100681. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_LUT4_I3": {
  100682. "hide_name": 0,
  100683. "type": "SB_LUT4",
  100684. "parameters": {
  100685. "LUT_INIT": "0110100110010110"
  100686. },
  100687. "attributes": {
  100688. "module_not_derived": "00000000000000000000000000000001",
  100689. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100690. },
  100691. "port_directions": {
  100692. "I0": "input",
  100693. "I1": "input",
  100694. "I2": "input",
  100695. "I3": "input",
  100696. "O": "output"
  100697. },
  100698. "connections": {
  100699. "I0": [ "0" ],
  100700. "I1": [ 4526 ],
  100701. "I2": [ "0" ],
  100702. "I3": [ 4524 ],
  100703. "O": [ 4527 ]
  100704. }
  100705. },
  100706. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_LUT4_I3_I1_SB_LUT4_O": {
  100707. "hide_name": 0,
  100708. "type": "SB_LUT4",
  100709. "parameters": {
  100710. "LUT_INIT": "0000111100000000"
  100711. },
  100712. "attributes": {
  100713. "module_not_derived": "00000000000000000000000000000001",
  100714. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100715. },
  100716. "port_directions": {
  100717. "I0": "input",
  100718. "I1": "input",
  100719. "I2": "input",
  100720. "I3": "input",
  100721. "O": "output"
  100722. },
  100723. "connections": {
  100724. "I0": [ "0" ],
  100725. "I1": [ "0" ],
  100726. "I2": [ 3674 ],
  100727. "I3": [ 4521 ],
  100728. "O": [ 4526 ]
  100729. }
  100730. },
  100731. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_LUT4_I3": {
  100732. "hide_name": 0,
  100733. "type": "SB_LUT4",
  100734. "parameters": {
  100735. "LUT_INIT": "0110100110010110"
  100736. },
  100737. "attributes": {
  100738. "module_not_derived": "00000000000000000000000000000001",
  100739. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100740. },
  100741. "port_directions": {
  100742. "I0": "input",
  100743. "I1": "input",
  100744. "I2": "input",
  100745. "I3": "input",
  100746. "O": "output"
  100747. },
  100748. "connections": {
  100749. "I0": [ "0" ],
  100750. "I1": [ 4525 ],
  100751. "I2": [ "0" ],
  100752. "I3": [ 4523 ],
  100753. "O": [ 4528 ]
  100754. }
  100755. },
  100756. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_LUT4_I3_I1_SB_LUT4_O": {
  100757. "hide_name": 0,
  100758. "type": "SB_LUT4",
  100759. "parameters": {
  100760. "LUT_INIT": "0000111100000000"
  100761. },
  100762. "attributes": {
  100763. "module_not_derived": "00000000000000000000000000000001",
  100764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100765. },
  100766. "port_directions": {
  100767. "I0": "input",
  100768. "I1": "input",
  100769. "I2": "input",
  100770. "I3": "input",
  100771. "O": "output"
  100772. },
  100773. "connections": {
  100774. "I0": [ "0" ],
  100775. "I1": [ "0" ],
  100776. "I2": [ 3676 ],
  100777. "I3": [ 4521 ],
  100778. "O": [ 4525 ]
  100779. }
  100780. },
  100781. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_LUT4_O": {
  100782. "hide_name": 0,
  100783. "type": "SB_LUT4",
  100784. "parameters": {
  100785. "LUT_INIT": "0000111100000000"
  100786. },
  100787. "attributes": {
  100788. "module_not_derived": "00000000000000000000000000000001",
  100789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100790. },
  100791. "port_directions": {
  100792. "I0": "input",
  100793. "I1": "input",
  100794. "I2": "input",
  100795. "I3": "input",
  100796. "O": "output"
  100797. },
  100798. "connections": {
  100799. "I0": [ "0" ],
  100800. "I1": [ "0" ],
  100801. "I2": [ 2913 ],
  100802. "I3": [ 4521 ],
  100803. "O": [ 4522 ]
  100804. }
  100805. },
  100806. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1": {
  100807. "hide_name": 0,
  100808. "type": "SB_CARRY",
  100809. "parameters": {
  100810. },
  100811. "attributes": {
  100812. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100813. },
  100814. "port_directions": {
  100815. "CI": "input",
  100816. "CO": "output",
  100817. "I0": "input",
  100818. "I1": "input"
  100819. },
  100820. "connections": {
  100821. "CI": [ "0" ],
  100822. "CO": [ 4529 ],
  100823. "I0": [ 4303 ],
  100824. "I1": [ 4520 ]
  100825. }
  100826. },
  100827. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI": {
  100828. "hide_name": 0,
  100829. "type": "SB_CARRY",
  100830. "parameters": {
  100831. },
  100832. "attributes": {
  100833. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100834. },
  100835. "port_directions": {
  100836. "CI": "input",
  100837. "CO": "output",
  100838. "I0": "input",
  100839. "I1": "input"
  100840. },
  100841. "connections": {
  100842. "CI": [ 4529 ],
  100843. "CO": [ 4530 ],
  100844. "I0": [ 4531 ],
  100845. "I1": [ "0" ]
  100846. }
  100847. },
  100848. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_CARRY_CI": {
  100849. "hide_name": 0,
  100850. "type": "SB_CARRY",
  100851. "parameters": {
  100852. },
  100853. "attributes": {
  100854. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  100855. },
  100856. "port_directions": {
  100857. "CI": "input",
  100858. "CO": "output",
  100859. "I0": "input",
  100860. "I1": "input"
  100861. },
  100862. "connections": {
  100863. "CI": [ 4530 ],
  100864. "CO": [ 4480 ],
  100865. "I0": [ 4532 ],
  100866. "I1": [ "0" ]
  100867. }
  100868. },
  100869. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_LUT4_I3": {
  100870. "hide_name": 0,
  100871. "type": "SB_LUT4",
  100872. "parameters": {
  100873. "LUT_INIT": "0110100110010110"
  100874. },
  100875. "attributes": {
  100876. "module_not_derived": "00000000000000000000000000000001",
  100877. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100878. },
  100879. "port_directions": {
  100880. "I0": "input",
  100881. "I1": "input",
  100882. "I2": "input",
  100883. "I3": "input",
  100884. "O": "output"
  100885. },
  100886. "connections": {
  100887. "I0": [ "0" ],
  100888. "I1": [ 4532 ],
  100889. "I2": [ "0" ],
  100890. "I3": [ 4530 ],
  100891. "O": [ 4533 ]
  100892. }
  100893. },
  100894. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_LUT4_I3_I1_SB_LUT4_O": {
  100895. "hide_name": 0,
  100896. "type": "SB_LUT4",
  100897. "parameters": {
  100898. "LUT_INIT": "0000111100000000"
  100899. },
  100900. "attributes": {
  100901. "module_not_derived": "00000000000000000000000000000001",
  100902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100903. },
  100904. "port_directions": {
  100905. "I0": "input",
  100906. "I1": "input",
  100907. "I2": "input",
  100908. "I3": "input",
  100909. "O": "output"
  100910. },
  100911. "connections": {
  100912. "I0": [ "0" ],
  100913. "I1": [ "0" ],
  100914. "I2": [ 4059 ],
  100915. "I3": [ 4303 ],
  100916. "O": [ 4532 ]
  100917. }
  100918. },
  100919. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_LUT4_I3": {
  100920. "hide_name": 0,
  100921. "type": "SB_LUT4",
  100922. "parameters": {
  100923. "LUT_INIT": "0110100110010110"
  100924. },
  100925. "attributes": {
  100926. "module_not_derived": "00000000000000000000000000000001",
  100927. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  100928. },
  100929. "port_directions": {
  100930. "I0": "input",
  100931. "I1": "input",
  100932. "I2": "input",
  100933. "I3": "input",
  100934. "O": "output"
  100935. },
  100936. "connections": {
  100937. "I0": [ "0" ],
  100938. "I1": [ 4531 ],
  100939. "I2": [ "0" ],
  100940. "I3": [ 4529 ],
  100941. "O": [ 4534 ]
  100942. }
  100943. },
  100944. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_LUT4_I3_I1_SB_LUT4_O": {
  100945. "hide_name": 0,
  100946. "type": "SB_LUT4",
  100947. "parameters": {
  100948. "LUT_INIT": "0000111100000000"
  100949. },
  100950. "attributes": {
  100951. "module_not_derived": "00000000000000000000000000000001",
  100952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100953. },
  100954. "port_directions": {
  100955. "I0": "input",
  100956. "I1": "input",
  100957. "I2": "input",
  100958. "I3": "input",
  100959. "O": "output"
  100960. },
  100961. "connections": {
  100962. "I0": [ "0" ],
  100963. "I1": [ "0" ],
  100964. "I2": [ 4064 ],
  100965. "I3": [ 4303 ],
  100966. "O": [ 4531 ]
  100967. }
  100968. },
  100969. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  100970. "hide_name": 0,
  100971. "type": "SB_LUT4",
  100972. "parameters": {
  100973. "LUT_INIT": "0000111100000000"
  100974. },
  100975. "attributes": {
  100976. "module_not_derived": "00000000000000000000000000000001",
  100977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  100978. },
  100979. "port_directions": {
  100980. "I0": "input",
  100981. "I1": "input",
  100982. "I2": "input",
  100983. "I3": "input",
  100984. "O": "output"
  100985. },
  100986. "connections": {
  100987. "I0": [ "0" ],
  100988. "I1": [ "0" ],
  100989. "I2": [ 4069 ],
  100990. "I3": [ 4303 ],
  100991. "O": [ 4520 ]
  100992. }
  100993. },
  100994. "cpu_I.execute_MUL_HH_SB_LUT4_O_1_I1_SB_LUT4_O": {
  100995. "hide_name": 0,
  100996. "type": "SB_LUT4",
  100997. "parameters": {
  100998. "LUT_INIT": "1111110011000000"
  100999. },
  101000. "attributes": {
  101001. "module_not_derived": "00000000000000000000000000000001",
  101002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101003. },
  101004. "port_directions": {
  101005. "I0": "input",
  101006. "I1": "input",
  101007. "I2": "input",
  101008. "I3": "input",
  101009. "O": "output"
  101010. },
  101011. "connections": {
  101012. "I0": [ "0" ],
  101013. "I1": [ 4513 ],
  101014. "I2": [ 4514 ],
  101015. "I3": [ 4515 ],
  101016. "O": [ 4466 ]
  101017. }
  101018. },
  101019. "cpu_I.execute_MUL_HH_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  101020. "hide_name": 0,
  101021. "type": "SB_CARRY",
  101022. "parameters": {
  101023. },
  101024. "attributes": {
  101025. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101026. },
  101027. "port_directions": {
  101028. "CI": "input",
  101029. "CO": "output",
  101030. "I0": "input",
  101031. "I1": "input"
  101032. },
  101033. "connections": {
  101034. "CI": [ 4511 ],
  101035. "CO": [ 4467 ],
  101036. "I0": [ 4509 ],
  101037. "I1": [ 4510 ]
  101038. }
  101039. },
  101040. "cpu_I.execute_MUL_HH_SB_LUT4_O_2": {
  101041. "hide_name": 0,
  101042. "type": "SB_LUT4",
  101043. "parameters": {
  101044. "LUT_INIT": "0110100110010110"
  101045. },
  101046. "attributes": {
  101047. "module_not_derived": "00000000000000000000000000000001",
  101048. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101049. },
  101050. "port_directions": {
  101051. "I0": "input",
  101052. "I1": "input",
  101053. "I2": "input",
  101054. "I3": "input",
  101055. "O": "output"
  101056. },
  101057. "connections": {
  101058. "I0": [ "0" ],
  101059. "I1": [ 4535 ],
  101060. "I2": [ 4536 ],
  101061. "I3": [ 4537 ],
  101062. "O": [ 4538 ]
  101063. }
  101064. },
  101065. "cpu_I.execute_MUL_HH_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  101066. "hide_name": 0,
  101067. "type": "SB_CARRY",
  101068. "parameters": {
  101069. },
  101070. "attributes": {
  101071. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101072. },
  101073. "port_directions": {
  101074. "CI": "input",
  101075. "CO": "output",
  101076. "I0": "input",
  101077. "I1": "input"
  101078. },
  101079. "connections": {
  101080. "CI": [ 4467 ],
  101081. "CO": [ 4537 ],
  101082. "I0": [ 4465 ],
  101083. "I1": [ 4466 ]
  101084. }
  101085. },
  101086. "cpu_I.execute_MUL_HH_SB_LUT4_O_3": {
  101087. "hide_name": 0,
  101088. "type": "SB_LUT4",
  101089. "parameters": {
  101090. "LUT_INIT": "0110100110010110"
  101091. },
  101092. "attributes": {
  101093. "module_not_derived": "00000000000000000000000000000001",
  101094. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101095. },
  101096. "port_directions": {
  101097. "I0": "input",
  101098. "I1": "input",
  101099. "I2": "input",
  101100. "I3": "input",
  101101. "O": "output"
  101102. },
  101103. "connections": {
  101104. "I0": [ "0" ],
  101105. "I1": [ 4539 ],
  101106. "I2": [ 4540 ],
  101107. "I3": [ 4541 ],
  101108. "O": [ 4542 ]
  101109. }
  101110. },
  101111. "cpu_I.execute_MUL_HH_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  101112. "hide_name": 0,
  101113. "type": "SB_CARRY",
  101114. "parameters": {
  101115. },
  101116. "attributes": {
  101117. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101118. },
  101119. "port_directions": {
  101120. "CI": "input",
  101121. "CO": "output",
  101122. "I0": "input",
  101123. "I1": "input"
  101124. },
  101125. "connections": {
  101126. "CI": [ 4537 ],
  101127. "CO": [ 4541 ],
  101128. "I0": [ 4535 ],
  101129. "I1": [ 4536 ]
  101130. }
  101131. },
  101132. "cpu_I.execute_MUL_HH_SB_LUT4_O_4": {
  101133. "hide_name": 0,
  101134. "type": "SB_LUT4",
  101135. "parameters": {
  101136. "LUT_INIT": "0110100110010110"
  101137. },
  101138. "attributes": {
  101139. "module_not_derived": "00000000000000000000000000000001",
  101140. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101141. },
  101142. "port_directions": {
  101143. "I0": "input",
  101144. "I1": "input",
  101145. "I2": "input",
  101146. "I3": "input",
  101147. "O": "output"
  101148. },
  101149. "connections": {
  101150. "I0": [ "0" ],
  101151. "I1": [ 4543 ],
  101152. "I2": [ 4544 ],
  101153. "I3": [ 4545 ],
  101154. "O": [ 4546 ]
  101155. }
  101156. },
  101157. "cpu_I.execute_MUL_HH_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  101158. "hide_name": 0,
  101159. "type": "SB_CARRY",
  101160. "parameters": {
  101161. },
  101162. "attributes": {
  101163. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101164. },
  101165. "port_directions": {
  101166. "CI": "input",
  101167. "CO": "output",
  101168. "I0": "input",
  101169. "I1": "input"
  101170. },
  101171. "connections": {
  101172. "CI": [ 4541 ],
  101173. "CO": [ 4545 ],
  101174. "I0": [ 4539 ],
  101175. "I1": [ 4540 ]
  101176. }
  101177. },
  101178. "cpu_I.execute_MUL_HH_SB_LUT4_O_5": {
  101179. "hide_name": 0,
  101180. "type": "SB_LUT4",
  101181. "parameters": {
  101182. "LUT_INIT": "0110100110010110"
  101183. },
  101184. "attributes": {
  101185. "module_not_derived": "00000000000000000000000000000001",
  101186. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101187. },
  101188. "port_directions": {
  101189. "I0": "input",
  101190. "I1": "input",
  101191. "I2": "input",
  101192. "I3": "input",
  101193. "O": "output"
  101194. },
  101195. "connections": {
  101196. "I0": [ "0" ],
  101197. "I1": [ 4547 ],
  101198. "I2": [ 4548 ],
  101199. "I3": [ 4549 ],
  101200. "O": [ 4550 ]
  101201. }
  101202. },
  101203. "cpu_I.execute_MUL_HH_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  101204. "hide_name": 0,
  101205. "type": "SB_CARRY",
  101206. "parameters": {
  101207. },
  101208. "attributes": {
  101209. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101210. },
  101211. "port_directions": {
  101212. "CI": "input",
  101213. "CO": "output",
  101214. "I0": "input",
  101215. "I1": "input"
  101216. },
  101217. "connections": {
  101218. "CI": [ 4545 ],
  101219. "CO": [ 4549 ],
  101220. "I0": [ 4543 ],
  101221. "I1": [ 4544 ]
  101222. }
  101223. },
  101224. "cpu_I.execute_MUL_HH_SB_LUT4_O_6": {
  101225. "hide_name": 0,
  101226. "type": "SB_LUT4",
  101227. "parameters": {
  101228. "LUT_INIT": "0110100110010110"
  101229. },
  101230. "attributes": {
  101231. "module_not_derived": "00000000000000000000000000000001",
  101232. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101233. },
  101234. "port_directions": {
  101235. "I0": "input",
  101236. "I1": "input",
  101237. "I2": "input",
  101238. "I3": "input",
  101239. "O": "output"
  101240. },
  101241. "connections": {
  101242. "I0": [ "0" ],
  101243. "I1": [ 4551 ],
  101244. "I2": [ 4552 ],
  101245. "I3": [ 4553 ],
  101246. "O": [ 4554 ]
  101247. }
  101248. },
  101249. "cpu_I.execute_MUL_HH_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  101250. "hide_name": 0,
  101251. "type": "SB_CARRY",
  101252. "parameters": {
  101253. },
  101254. "attributes": {
  101255. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101256. },
  101257. "port_directions": {
  101258. "CI": "input",
  101259. "CO": "output",
  101260. "I0": "input",
  101261. "I1": "input"
  101262. },
  101263. "connections": {
  101264. "CI": [ 4549 ],
  101265. "CO": [ 4553 ],
  101266. "I0": [ 4547 ],
  101267. "I1": [ 4548 ]
  101268. }
  101269. },
  101270. "cpu_I.execute_MUL_HH_SB_LUT4_O_7": {
  101271. "hide_name": 0,
  101272. "type": "SB_LUT4",
  101273. "parameters": {
  101274. "LUT_INIT": "0110100110010110"
  101275. },
  101276. "attributes": {
  101277. "module_not_derived": "00000000000000000000000000000001",
  101278. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101279. },
  101280. "port_directions": {
  101281. "I0": "input",
  101282. "I1": "input",
  101283. "I2": "input",
  101284. "I3": "input",
  101285. "O": "output"
  101286. },
  101287. "connections": {
  101288. "I0": [ "0" ],
  101289. "I1": [ 4555 ],
  101290. "I2": [ 4556 ],
  101291. "I3": [ "0" ],
  101292. "O": [ 4557 ]
  101293. }
  101294. },
  101295. "cpu_I.execute_MUL_HH_SB_LUT4_O_7_I1_SB_LUT4_O": {
  101296. "hide_name": 0,
  101297. "type": "SB_LUT4",
  101298. "parameters": {
  101299. "LUT_INIT": "1111110011000000"
  101300. },
  101301. "attributes": {
  101302. "module_not_derived": "00000000000000000000000000000001",
  101303. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101304. },
  101305. "port_directions": {
  101306. "I0": "input",
  101307. "I1": "input",
  101308. "I2": "input",
  101309. "I3": "input",
  101310. "O": "output"
  101311. },
  101312. "connections": {
  101313. "I0": [ "0" ],
  101314. "I1": [ 4516 ],
  101315. "I2": [ 4517 ],
  101316. "I3": [ 4518 ],
  101317. "O": [ 4556 ]
  101318. }
  101319. },
  101320. "cpu_I.execute_MUL_HH_SB_LUT4_O_7_I1_SB_LUT4_O_1": {
  101321. "hide_name": 0,
  101322. "type": "SB_LUT4",
  101323. "parameters": {
  101324. "LUT_INIT": "1100001100111100"
  101325. },
  101326. "attributes": {
  101327. "module_not_derived": "00000000000000000000000000000001",
  101328. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101329. },
  101330. "port_directions": {
  101331. "I0": "input",
  101332. "I1": "input",
  101333. "I2": "input",
  101334. "I3": "input",
  101335. "O": "output"
  101336. },
  101337. "connections": {
  101338. "I0": [ "0" ],
  101339. "I1": [ 4558 ],
  101340. "I2": [ 4528 ],
  101341. "I3": [ 4534 ],
  101342. "O": [ 4555 ]
  101343. }
  101344. },
  101345. "cpu_I.execute_MUL_HH_SB_LUT4_O_8": {
  101346. "hide_name": 0,
  101347. "type": "SB_LUT4",
  101348. "parameters": {
  101349. "LUT_INIT": "0110100110010110"
  101350. },
  101351. "attributes": {
  101352. "module_not_derived": "00000000000000000000000000000001",
  101353. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101354. },
  101355. "port_directions": {
  101356. "I0": "input",
  101357. "I1": "input",
  101358. "I2": "input",
  101359. "I3": "input",
  101360. "O": "output"
  101361. },
  101362. "connections": {
  101363. "I0": [ "0" ],
  101364. "I1": [ 4559 ],
  101365. "I2": [ 4560 ],
  101366. "I3": [ 4561 ],
  101367. "O": [ 4562 ]
  101368. }
  101369. },
  101370. "cpu_I.execute_MUL_HH_SB_LUT4_O_8_I1_SB_LUT4_O": {
  101371. "hide_name": 0,
  101372. "type": "SB_LUT4",
  101373. "parameters": {
  101374. "LUT_INIT": "1111110011000000"
  101375. },
  101376. "attributes": {
  101377. "module_not_derived": "00000000000000000000000000000001",
  101378. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101379. },
  101380. "port_directions": {
  101381. "I0": "input",
  101382. "I1": "input",
  101383. "I2": "input",
  101384. "I3": "input",
  101385. "O": "output"
  101386. },
  101387. "connections": {
  101388. "I0": [ "0" ],
  101389. "I1": [ 4558 ],
  101390. "I2": [ 4528 ],
  101391. "I3": [ 4534 ],
  101392. "O": [ 4560 ]
  101393. }
  101394. },
  101395. "cpu_I.execute_MUL_HH_SB_LUT4_O_8_I1_SB_LUT4_O_1": {
  101396. "hide_name": 0,
  101397. "type": "SB_LUT4",
  101398. "parameters": {
  101399. "LUT_INIT": "1100001100111100"
  101400. },
  101401. "attributes": {
  101402. "module_not_derived": "00000000000000000000000000000001",
  101403. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101404. },
  101405. "port_directions": {
  101406. "I0": "input",
  101407. "I1": "input",
  101408. "I2": "input",
  101409. "I3": "input",
  101410. "O": "output"
  101411. },
  101412. "connections": {
  101413. "I0": [ "0" ],
  101414. "I1": [ 4563 ],
  101415. "I2": [ 4527 ],
  101416. "I3": [ 4533 ],
  101417. "O": [ 4559 ]
  101418. }
  101419. },
  101420. "cpu_I.execute_MUL_HH_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  101421. "hide_name": 0,
  101422. "type": "SB_CARRY",
  101423. "parameters": {
  101424. },
  101425. "attributes": {
  101426. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101427. },
  101428. "port_directions": {
  101429. "CI": "input",
  101430. "CO": "output",
  101431. "I0": "input",
  101432. "I1": "input"
  101433. },
  101434. "connections": {
  101435. "CI": [ "0" ],
  101436. "CO": [ 4561 ],
  101437. "I0": [ 4555 ],
  101438. "I1": [ 4556 ]
  101439. }
  101440. },
  101441. "cpu_I.execute_MUL_HH_SB_LUT4_O_9": {
  101442. "hide_name": 0,
  101443. "type": "SB_LUT4",
  101444. "parameters": {
  101445. "LUT_INIT": "0110100110010110"
  101446. },
  101447. "attributes": {
  101448. "module_not_derived": "00000000000000000000000000000001",
  101449. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101450. },
  101451. "port_directions": {
  101452. "I0": "input",
  101453. "I1": "input",
  101454. "I2": "input",
  101455. "I3": "input",
  101456. "O": "output"
  101457. },
  101458. "connections": {
  101459. "I0": [ "0" ],
  101460. "I1": [ 4484 ],
  101461. "I2": [ 4485 ],
  101462. "I3": [ 4483 ],
  101463. "O": [ 4564 ]
  101464. }
  101465. },
  101466. "cpu_I.execute_MUL_HH_SB_LUT4_O_9_I1_SB_LUT4_O": {
  101467. "hide_name": 0,
  101468. "type": "SB_LUT4",
  101469. "parameters": {
  101470. "LUT_INIT": "1111110011000000"
  101471. },
  101472. "attributes": {
  101473. "module_not_derived": "00000000000000000000000000000001",
  101474. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101475. },
  101476. "port_directions": {
  101477. "I0": "input",
  101478. "I1": "input",
  101479. "I2": "input",
  101480. "I3": "input",
  101481. "O": "output"
  101482. },
  101483. "connections": {
  101484. "I0": [ "0" ],
  101485. "I1": [ 4563 ],
  101486. "I2": [ 4527 ],
  101487. "I3": [ 4533 ],
  101488. "O": [ 4485 ]
  101489. }
  101490. },
  101491. "cpu_I.execute_MUL_HH_SB_LUT4_O_9_I1_SB_LUT4_O_1": {
  101492. "hide_name": 0,
  101493. "type": "SB_LUT4",
  101494. "parameters": {
  101495. "LUT_INIT": "1100001100111100"
  101496. },
  101497. "attributes": {
  101498. "module_not_derived": "00000000000000000000000000000001",
  101499. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101500. },
  101501. "port_directions": {
  101502. "I0": "input",
  101503. "I1": "input",
  101504. "I2": "input",
  101505. "I3": "input",
  101506. "O": "output"
  101507. },
  101508. "connections": {
  101509. "I0": [ "0" ],
  101510. "I1": [ 4473 ],
  101511. "I2": [ 4474 ],
  101512. "I3": [ 4475 ],
  101513. "O": [ 4484 ]
  101514. }
  101515. },
  101516. "cpu_I.execute_MUL_HH_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  101517. "hide_name": 0,
  101518. "type": "SB_CARRY",
  101519. "parameters": {
  101520. },
  101521. "attributes": {
  101522. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101523. },
  101524. "port_directions": {
  101525. "CI": "input",
  101526. "CO": "output",
  101527. "I0": "input",
  101528. "I1": "input"
  101529. },
  101530. "connections": {
  101531. "CI": [ 4561 ],
  101532. "CO": [ 4483 ],
  101533. "I0": [ 4559 ],
  101534. "I1": [ 4560 ]
  101535. }
  101536. },
  101537. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O": {
  101538. "hide_name": 0,
  101539. "type": "SB_LUT4",
  101540. "parameters": {
  101541. "LUT_INIT": "0110100110010110"
  101542. },
  101543. "attributes": {
  101544. "module_not_derived": "00000000000000000000000000000001",
  101545. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101546. },
  101547. "port_directions": {
  101548. "I0": "input",
  101549. "I1": "input",
  101550. "I2": "input",
  101551. "I3": "input",
  101552. "O": "output"
  101553. },
  101554. "connections": {
  101555. "I0": [ 4565 ],
  101556. "I1": [ 4566 ],
  101557. "I2": [ 4567 ],
  101558. "I3": [ 4568 ],
  101559. "O": [ 4461 ]
  101560. }
  101561. },
  101562. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_1": {
  101563. "hide_name": 0,
  101564. "type": "SB_LUT4",
  101565. "parameters": {
  101566. "LUT_INIT": "1111110011000000"
  101567. },
  101568. "attributes": {
  101569. "module_not_derived": "00000000000000000000000000000001",
  101570. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  101571. },
  101572. "port_directions": {
  101573. "I0": "input",
  101574. "I1": "input",
  101575. "I2": "input",
  101576. "I3": "input",
  101577. "O": "output"
  101578. },
  101579. "connections": {
  101580. "I0": [ "0" ],
  101581. "I1": [ 4569 ],
  101582. "I2": [ 4570 ],
  101583. "I3": [ 4571 ],
  101584. "O": [ 4462 ]
  101585. }
  101586. },
  101587. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O": {
  101588. "hide_name": 0,
  101589. "type": "SB_LUT4",
  101590. "parameters": {
  101591. "LUT_INIT": "1011101101000100"
  101592. },
  101593. "attributes": {
  101594. "module_not_derived": "00000000000000000000000000000001",
  101595. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  101596. },
  101597. "port_directions": {
  101598. "I0": "input",
  101599. "I1": "input",
  101600. "I2": "input",
  101601. "I3": "input",
  101602. "O": "output"
  101603. },
  101604. "connections": {
  101605. "I0": [ 2843 ],
  101606. "I1": [ 4303 ],
  101607. "I2": [ "0" ],
  101608. "I3": [ 4572 ],
  101609. "O": [ 4567 ]
  101610. }
  101611. },
  101612. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_1": {
  101613. "hide_name": 0,
  101614. "type": "SB_LUT4",
  101615. "parameters": {
  101616. "LUT_INIT": "0000111100000000"
  101617. },
  101618. "attributes": {
  101619. "module_not_derived": "00000000000000000000000000000001",
  101620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  101621. },
  101622. "port_directions": {
  101623. "I0": "input",
  101624. "I1": "input",
  101625. "I2": "input",
  101626. "I3": "input",
  101627. "O": "output"
  101628. },
  101629. "connections": {
  101630. "I0": [ "0" ],
  101631. "I1": [ "0" ],
  101632. "I2": [ 3661 ],
  101633. "I3": [ 4521 ],
  101634. "O": [ 4566 ]
  101635. }
  101636. },
  101637. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO": {
  101638. "hide_name": 0,
  101639. "type": "SB_CARRY",
  101640. "parameters": {
  101641. },
  101642. "attributes": {
  101643. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101644. },
  101645. "port_directions": {
  101646. "CI": "input",
  101647. "CO": "output",
  101648. "I0": "input",
  101649. "I1": "input"
  101650. },
  101651. "connections": {
  101652. "CI": [ 4573 ],
  101653. "CO": [ 4572 ],
  101654. "I0": [ 4574 ],
  101655. "I1": [ "0" ]
  101656. }
  101657. },
  101658. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101659. "hide_name": 0,
  101660. "type": "SB_CARRY",
  101661. "parameters": {
  101662. },
  101663. "attributes": {
  101664. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101665. },
  101666. "port_directions": {
  101667. "CI": "input",
  101668. "CO": "output",
  101669. "I0": "input",
  101670. "I1": "input"
  101671. },
  101672. "connections": {
  101673. "CI": [ 4575 ],
  101674. "CO": [ 4573 ],
  101675. "I0": [ 4576 ],
  101676. "I1": [ "0" ]
  101677. }
  101678. },
  101679. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101680. "hide_name": 0,
  101681. "type": "SB_CARRY",
  101682. "parameters": {
  101683. },
  101684. "attributes": {
  101685. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101686. },
  101687. "port_directions": {
  101688. "CI": "input",
  101689. "CO": "output",
  101690. "I0": "input",
  101691. "I1": "input"
  101692. },
  101693. "connections": {
  101694. "CI": [ 4577 ],
  101695. "CO": [ 4575 ],
  101696. "I0": [ 4578 ],
  101697. "I1": [ "0" ]
  101698. }
  101699. },
  101700. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101701. "hide_name": 0,
  101702. "type": "SB_CARRY",
  101703. "parameters": {
  101704. },
  101705. "attributes": {
  101706. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101707. },
  101708. "port_directions": {
  101709. "CI": "input",
  101710. "CO": "output",
  101711. "I0": "input",
  101712. "I1": "input"
  101713. },
  101714. "connections": {
  101715. "CI": [ 4579 ],
  101716. "CO": [ 4577 ],
  101717. "I0": [ 4580 ],
  101718. "I1": [ "0" ]
  101719. }
  101720. },
  101721. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101722. "hide_name": 0,
  101723. "type": "SB_CARRY",
  101724. "parameters": {
  101725. },
  101726. "attributes": {
  101727. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101728. },
  101729. "port_directions": {
  101730. "CI": "input",
  101731. "CO": "output",
  101732. "I0": "input",
  101733. "I1": "input"
  101734. },
  101735. "connections": {
  101736. "CI": [ 4581 ],
  101737. "CO": [ 4579 ],
  101738. "I0": [ 4582 ],
  101739. "I1": [ "0" ]
  101740. }
  101741. },
  101742. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101743. "hide_name": 0,
  101744. "type": "SB_CARRY",
  101745. "parameters": {
  101746. },
  101747. "attributes": {
  101748. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101749. },
  101750. "port_directions": {
  101751. "CI": "input",
  101752. "CO": "output",
  101753. "I0": "input",
  101754. "I1": "input"
  101755. },
  101756. "connections": {
  101757. "CI": [ 4583 ],
  101758. "CO": [ 4581 ],
  101759. "I0": [ 4584 ],
  101760. "I1": [ "0" ]
  101761. }
  101762. },
  101763. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101764. "hide_name": 0,
  101765. "type": "SB_CARRY",
  101766. "parameters": {
  101767. },
  101768. "attributes": {
  101769. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101770. },
  101771. "port_directions": {
  101772. "CI": "input",
  101773. "CO": "output",
  101774. "I0": "input",
  101775. "I1": "input"
  101776. },
  101777. "connections": {
  101778. "CI": [ 4585 ],
  101779. "CO": [ 4583 ],
  101780. "I0": [ 4586 ],
  101781. "I1": [ "0" ]
  101782. }
  101783. },
  101784. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101785. "hide_name": 0,
  101786. "type": "SB_CARRY",
  101787. "parameters": {
  101788. },
  101789. "attributes": {
  101790. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101791. },
  101792. "port_directions": {
  101793. "CI": "input",
  101794. "CO": "output",
  101795. "I0": "input",
  101796. "I1": "input"
  101797. },
  101798. "connections": {
  101799. "CI": [ 4587 ],
  101800. "CO": [ 4585 ],
  101801. "I0": [ 4588 ],
  101802. "I1": [ "0" ]
  101803. }
  101804. },
  101805. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101806. "hide_name": 0,
  101807. "type": "SB_CARRY",
  101808. "parameters": {
  101809. },
  101810. "attributes": {
  101811. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101812. },
  101813. "port_directions": {
  101814. "CI": "input",
  101815. "CO": "output",
  101816. "I0": "input",
  101817. "I1": "input"
  101818. },
  101819. "connections": {
  101820. "CI": [ 4589 ],
  101821. "CO": [ 4587 ],
  101822. "I0": [ 4590 ],
  101823. "I1": [ "0" ]
  101824. }
  101825. },
  101826. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101827. "hide_name": 0,
  101828. "type": "SB_CARRY",
  101829. "parameters": {
  101830. },
  101831. "attributes": {
  101832. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101833. },
  101834. "port_directions": {
  101835. "CI": "input",
  101836. "CO": "output",
  101837. "I0": "input",
  101838. "I1": "input"
  101839. },
  101840. "connections": {
  101841. "CI": [ 4591 ],
  101842. "CO": [ 4589 ],
  101843. "I0": [ 4592 ],
  101844. "I1": [ "0" ]
  101845. }
  101846. },
  101847. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101848. "hide_name": 0,
  101849. "type": "SB_CARRY",
  101850. "parameters": {
  101851. },
  101852. "attributes": {
  101853. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101854. },
  101855. "port_directions": {
  101856. "CI": "input",
  101857. "CO": "output",
  101858. "I0": "input",
  101859. "I1": "input"
  101860. },
  101861. "connections": {
  101862. "CI": [ 4494 ],
  101863. "CO": [ 4591 ],
  101864. "I0": [ 4493 ],
  101865. "I1": [ "0" ]
  101866. }
  101867. },
  101868. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  101869. "hide_name": 0,
  101870. "type": "SB_CARRY",
  101871. "parameters": {
  101872. },
  101873. "attributes": {
  101874. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  101875. },
  101876. "port_directions": {
  101877. "CI": "input",
  101878. "CO": "output",
  101879. "I0": "input",
  101880. "I1": "input"
  101881. },
  101882. "connections": {
  101883. "CI": [ 4480 ],
  101884. "CO": [ 4494 ],
  101885. "I0": [ 4479 ],
  101886. "I1": [ "0" ]
  101887. }
  101888. },
  101889. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  101890. "hide_name": 0,
  101891. "type": "SB_LUT4",
  101892. "parameters": {
  101893. "LUT_INIT": "0000111100000000"
  101894. },
  101895. "attributes": {
  101896. "module_not_derived": "00000000000000000000000000000001",
  101897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  101898. },
  101899. "port_directions": {
  101900. "I0": "input",
  101901. "I1": "input",
  101902. "I2": "input",
  101903. "I3": "input",
  101904. "O": "output"
  101905. },
  101906. "connections": {
  101907. "I0": [ "0" ],
  101908. "I1": [ "0" ],
  101909. "I2": [ 2851 ],
  101910. "I3": [ 4303 ],
  101911. "O": [ 4493 ]
  101912. }
  101913. },
  101914. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  101915. "hide_name": 0,
  101916. "type": "SB_LUT4",
  101917. "parameters": {
  101918. "LUT_INIT": "0000111100000000"
  101919. },
  101920. "attributes": {
  101921. "module_not_derived": "00000000000000000000000000000001",
  101922. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  101923. },
  101924. "port_directions": {
  101925. "I0": "input",
  101926. "I1": "input",
  101927. "I2": "input",
  101928. "I3": "input",
  101929. "O": "output"
  101930. },
  101931. "connections": {
  101932. "I0": [ "0" ],
  101933. "I1": [ "0" ],
  101934. "I2": [ 4038 ],
  101935. "I3": [ 4303 ],
  101936. "O": [ 4592 ]
  101937. }
  101938. },
  101939. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  101940. "hide_name": 0,
  101941. "type": "SB_LUT4",
  101942. "parameters": {
  101943. "LUT_INIT": "0000111100000000"
  101944. },
  101945. "attributes": {
  101946. "module_not_derived": "00000000000000000000000000000001",
  101947. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  101948. },
  101949. "port_directions": {
  101950. "I0": "input",
  101951. "I1": "input",
  101952. "I2": "input",
  101953. "I3": "input",
  101954. "O": "output"
  101955. },
  101956. "connections": {
  101957. "I0": [ "0" ],
  101958. "I1": [ "0" ],
  101959. "I2": [ 4033 ],
  101960. "I3": [ 4303 ],
  101961. "O": [ 4590 ]
  101962. }
  101963. },
  101964. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  101965. "hide_name": 0,
  101966. "type": "SB_LUT4",
  101967. "parameters": {
  101968. "LUT_INIT": "0000111100000000"
  101969. },
  101970. "attributes": {
  101971. "module_not_derived": "00000000000000000000000000000001",
  101972. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  101973. },
  101974. "port_directions": {
  101975. "I0": "input",
  101976. "I1": "input",
  101977. "I2": "input",
  101978. "I3": "input",
  101979. "O": "output"
  101980. },
  101981. "connections": {
  101982. "I0": [ "0" ],
  101983. "I1": [ "0" ],
  101984. "I2": [ 4028 ],
  101985. "I3": [ 4303 ],
  101986. "O": [ 4588 ]
  101987. }
  101988. },
  101989. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  101990. "hide_name": 0,
  101991. "type": "SB_LUT4",
  101992. "parameters": {
  101993. "LUT_INIT": "0000111100000000"
  101994. },
  101995. "attributes": {
  101996. "module_not_derived": "00000000000000000000000000000001",
  101997. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  101998. },
  101999. "port_directions": {
  102000. "I0": "input",
  102001. "I1": "input",
  102002. "I2": "input",
  102003. "I3": "input",
  102004. "O": "output"
  102005. },
  102006. "connections": {
  102007. "I0": [ "0" ],
  102008. "I1": [ "0" ],
  102009. "I2": [ 2845 ],
  102010. "I3": [ 4303 ],
  102011. "O": [ 4586 ]
  102012. }
  102013. },
  102014. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102015. "hide_name": 0,
  102016. "type": "SB_LUT4",
  102017. "parameters": {
  102018. "LUT_INIT": "0000111100000000"
  102019. },
  102020. "attributes": {
  102021. "module_not_derived": "00000000000000000000000000000001",
  102022. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102023. },
  102024. "port_directions": {
  102025. "I0": "input",
  102026. "I1": "input",
  102027. "I2": "input",
  102028. "I3": "input",
  102029. "O": "output"
  102030. },
  102031. "connections": {
  102032. "I0": [ "0" ],
  102033. "I1": [ "0" ],
  102034. "I2": [ 4019 ],
  102035. "I3": [ 4303 ],
  102036. "O": [ 4584 ]
  102037. }
  102038. },
  102039. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102040. "hide_name": 0,
  102041. "type": "SB_LUT4",
  102042. "parameters": {
  102043. "LUT_INIT": "0000111100000000"
  102044. },
  102045. "attributes": {
  102046. "module_not_derived": "00000000000000000000000000000001",
  102047. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102048. },
  102049. "port_directions": {
  102050. "I0": "input",
  102051. "I1": "input",
  102052. "I2": "input",
  102053. "I3": "input",
  102054. "O": "output"
  102055. },
  102056. "connections": {
  102057. "I0": [ "0" ],
  102058. "I1": [ "0" ],
  102059. "I2": [ 4014 ],
  102060. "I3": [ 4303 ],
  102061. "O": [ 4582 ]
  102062. }
  102063. },
  102064. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102065. "hide_name": 0,
  102066. "type": "SB_LUT4",
  102067. "parameters": {
  102068. "LUT_INIT": "0000111100000000"
  102069. },
  102070. "attributes": {
  102071. "module_not_derived": "00000000000000000000000000000001",
  102072. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102073. },
  102074. "port_directions": {
  102075. "I0": "input",
  102076. "I1": "input",
  102077. "I2": "input",
  102078. "I3": "input",
  102079. "O": "output"
  102080. },
  102081. "connections": {
  102082. "I0": [ "0" ],
  102083. "I1": [ "0" ],
  102084. "I2": [ 4009 ],
  102085. "I3": [ 4303 ],
  102086. "O": [ 4580 ]
  102087. }
  102088. },
  102089. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102090. "hide_name": 0,
  102091. "type": "SB_LUT4",
  102092. "parameters": {
  102093. "LUT_INIT": "0000111100000000"
  102094. },
  102095. "attributes": {
  102096. "module_not_derived": "00000000000000000000000000000001",
  102097. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102098. },
  102099. "port_directions": {
  102100. "I0": "input",
  102101. "I1": "input",
  102102. "I2": "input",
  102103. "I3": "input",
  102104. "O": "output"
  102105. },
  102106. "connections": {
  102107. "I0": [ "0" ],
  102108. "I1": [ "0" ],
  102109. "I2": [ 2849 ],
  102110. "I3": [ 4303 ],
  102111. "O": [ 4578 ]
  102112. }
  102113. },
  102114. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102115. "hide_name": 0,
  102116. "type": "SB_LUT4",
  102117. "parameters": {
  102118. "LUT_INIT": "0000111100000000"
  102119. },
  102120. "attributes": {
  102121. "module_not_derived": "00000000000000000000000000000001",
  102122. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102123. },
  102124. "port_directions": {
  102125. "I0": "input",
  102126. "I1": "input",
  102127. "I2": "input",
  102128. "I3": "input",
  102129. "O": "output"
  102130. },
  102131. "connections": {
  102132. "I0": [ "0" ],
  102133. "I1": [ "0" ],
  102134. "I2": [ 2756 ],
  102135. "I3": [ 4303 ],
  102136. "O": [ 4576 ]
  102137. }
  102138. },
  102139. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_LUT4_O": {
  102140. "hide_name": 0,
  102141. "type": "SB_LUT4",
  102142. "parameters": {
  102143. "LUT_INIT": "0000111100000000"
  102144. },
  102145. "attributes": {
  102146. "module_not_derived": "00000000000000000000000000000001",
  102147. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102148. },
  102149. "port_directions": {
  102150. "I0": "input",
  102151. "I1": "input",
  102152. "I2": "input",
  102153. "I3": "input",
  102154. "O": "output"
  102155. },
  102156. "connections": {
  102157. "I0": [ "0" ],
  102158. "I1": [ "0" ],
  102159. "I2": [ 2771 ],
  102160. "I3": [ 4303 ],
  102161. "O": [ 4574 ]
  102162. }
  102163. },
  102164. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO": {
  102165. "hide_name": 0,
  102166. "type": "SB_CARRY",
  102167. "parameters": {
  102168. },
  102169. "attributes": {
  102170. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102171. },
  102172. "port_directions": {
  102173. "CI": "input",
  102174. "CO": "output",
  102175. "I0": "input",
  102176. "I1": "input"
  102177. },
  102178. "connections": {
  102179. "CI": [ 4593 ],
  102180. "CO": [ 4568 ],
  102181. "I0": [ 4594 ],
  102182. "I1": [ "0" ]
  102183. }
  102184. },
  102185. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102186. "hide_name": 0,
  102187. "type": "SB_CARRY",
  102188. "parameters": {
  102189. },
  102190. "attributes": {
  102191. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102192. },
  102193. "port_directions": {
  102194. "CI": "input",
  102195. "CO": "output",
  102196. "I0": "input",
  102197. "I1": "input"
  102198. },
  102199. "connections": {
  102200. "CI": [ 4595 ],
  102201. "CO": [ 4593 ],
  102202. "I0": [ 4596 ],
  102203. "I1": [ "0" ]
  102204. }
  102205. },
  102206. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102207. "hide_name": 0,
  102208. "type": "SB_CARRY",
  102209. "parameters": {
  102210. },
  102211. "attributes": {
  102212. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102213. },
  102214. "port_directions": {
  102215. "CI": "input",
  102216. "CO": "output",
  102217. "I0": "input",
  102218. "I1": "input"
  102219. },
  102220. "connections": {
  102221. "CI": [ 4597 ],
  102222. "CO": [ 4595 ],
  102223. "I0": [ 4598 ],
  102224. "I1": [ "0" ]
  102225. }
  102226. },
  102227. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102228. "hide_name": 0,
  102229. "type": "SB_CARRY",
  102230. "parameters": {
  102231. },
  102232. "attributes": {
  102233. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102234. },
  102235. "port_directions": {
  102236. "CI": "input",
  102237. "CO": "output",
  102238. "I0": "input",
  102239. "I1": "input"
  102240. },
  102241. "connections": {
  102242. "CI": [ 4599 ],
  102243. "CO": [ 4597 ],
  102244. "I0": [ 4600 ],
  102245. "I1": [ "0" ]
  102246. }
  102247. },
  102248. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102249. "hide_name": 0,
  102250. "type": "SB_CARRY",
  102251. "parameters": {
  102252. },
  102253. "attributes": {
  102254. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102255. },
  102256. "port_directions": {
  102257. "CI": "input",
  102258. "CO": "output",
  102259. "I0": "input",
  102260. "I1": "input"
  102261. },
  102262. "connections": {
  102263. "CI": [ 4601 ],
  102264. "CO": [ 4599 ],
  102265. "I0": [ 4602 ],
  102266. "I1": [ "0" ]
  102267. }
  102268. },
  102269. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102270. "hide_name": 0,
  102271. "type": "SB_CARRY",
  102272. "parameters": {
  102273. },
  102274. "attributes": {
  102275. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102276. },
  102277. "port_directions": {
  102278. "CI": "input",
  102279. "CO": "output",
  102280. "I0": "input",
  102281. "I1": "input"
  102282. },
  102283. "connections": {
  102284. "CI": [ 4603 ],
  102285. "CO": [ 4601 ],
  102286. "I0": [ 4604 ],
  102287. "I1": [ "0" ]
  102288. }
  102289. },
  102290. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102291. "hide_name": 0,
  102292. "type": "SB_CARRY",
  102293. "parameters": {
  102294. },
  102295. "attributes": {
  102296. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102297. },
  102298. "port_directions": {
  102299. "CI": "input",
  102300. "CO": "output",
  102301. "I0": "input",
  102302. "I1": "input"
  102303. },
  102304. "connections": {
  102305. "CI": [ 4605 ],
  102306. "CO": [ 4603 ],
  102307. "I0": [ 4606 ],
  102308. "I1": [ "0" ]
  102309. }
  102310. },
  102311. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102312. "hide_name": 0,
  102313. "type": "SB_CARRY",
  102314. "parameters": {
  102315. },
  102316. "attributes": {
  102317. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102318. },
  102319. "port_directions": {
  102320. "CI": "input",
  102321. "CO": "output",
  102322. "I0": "input",
  102323. "I1": "input"
  102324. },
  102325. "connections": {
  102326. "CI": [ 4607 ],
  102327. "CO": [ 4605 ],
  102328. "I0": [ 4608 ],
  102329. "I1": [ "0" ]
  102330. }
  102331. },
  102332. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102333. "hide_name": 0,
  102334. "type": "SB_CARRY",
  102335. "parameters": {
  102336. },
  102337. "attributes": {
  102338. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102339. },
  102340. "port_directions": {
  102341. "CI": "input",
  102342. "CO": "output",
  102343. "I0": "input",
  102344. "I1": "input"
  102345. },
  102346. "connections": {
  102347. "CI": [ 4609 ],
  102348. "CO": [ 4607 ],
  102349. "I0": [ 4610 ],
  102350. "I1": [ "0" ]
  102351. }
  102352. },
  102353. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102354. "hide_name": 0,
  102355. "type": "SB_CARRY",
  102356. "parameters": {
  102357. },
  102358. "attributes": {
  102359. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102360. },
  102361. "port_directions": {
  102362. "CI": "input",
  102363. "CO": "output",
  102364. "I0": "input",
  102365. "I1": "input"
  102366. },
  102367. "connections": {
  102368. "CI": [ 4611 ],
  102369. "CO": [ 4609 ],
  102370. "I0": [ 4612 ],
  102371. "I1": [ "0" ]
  102372. }
  102373. },
  102374. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102375. "hide_name": 0,
  102376. "type": "SB_CARRY",
  102377. "parameters": {
  102378. },
  102379. "attributes": {
  102380. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102381. },
  102382. "port_directions": {
  102383. "CI": "input",
  102384. "CO": "output",
  102385. "I0": "input",
  102386. "I1": "input"
  102387. },
  102388. "connections": {
  102389. "CI": [ 4613 ],
  102390. "CO": [ 4611 ],
  102391. "I0": [ 4614 ],
  102392. "I1": [ "0" ]
  102393. }
  102394. },
  102395. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  102396. "hide_name": 0,
  102397. "type": "SB_CARRY",
  102398. "parameters": {
  102399. },
  102400. "attributes": {
  102401. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  102402. },
  102403. "port_directions": {
  102404. "CI": "input",
  102405. "CO": "output",
  102406. "I0": "input",
  102407. "I1": "input"
  102408. },
  102409. "connections": {
  102410. "CI": [ 4482 ],
  102411. "CO": [ 4613 ],
  102412. "I0": [ 4481 ],
  102413. "I1": [ "0" ]
  102414. }
  102415. },
  102416. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102417. "hide_name": 0,
  102418. "type": "SB_LUT4",
  102419. "parameters": {
  102420. "LUT_INIT": "0000111100000000"
  102421. },
  102422. "attributes": {
  102423. "module_not_derived": "00000000000000000000000000000001",
  102424. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102425. },
  102426. "port_directions": {
  102427. "I0": "input",
  102428. "I1": "input",
  102429. "I2": "input",
  102430. "I3": "input",
  102431. "O": "output"
  102432. },
  102433. "connections": {
  102434. "I0": [ "0" ],
  102435. "I1": [ "0" ],
  102436. "I2": [ 3672 ],
  102437. "I3": [ 4521 ],
  102438. "O": [ 4481 ]
  102439. }
  102440. },
  102441. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102442. "hide_name": 0,
  102443. "type": "SB_LUT4",
  102444. "parameters": {
  102445. "LUT_INIT": "0110100110010110"
  102446. },
  102447. "attributes": {
  102448. "module_not_derived": "00000000000000000000000000000001",
  102449. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102450. },
  102451. "port_directions": {
  102452. "I0": "input",
  102453. "I1": "input",
  102454. "I2": "input",
  102455. "I3": "input",
  102456. "O": "output"
  102457. },
  102458. "connections": {
  102459. "I0": [ "0" ],
  102460. "I1": [ 4614 ],
  102461. "I2": [ "0" ],
  102462. "I3": [ 4613 ],
  102463. "O": [ 4477 ]
  102464. }
  102465. },
  102466. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102467. "hide_name": 0,
  102468. "type": "SB_LUT4",
  102469. "parameters": {
  102470. "LUT_INIT": "0000111100000000"
  102471. },
  102472. "attributes": {
  102473. "module_not_derived": "00000000000000000000000000000001",
  102474. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102475. },
  102476. "port_directions": {
  102477. "I0": "input",
  102478. "I1": "input",
  102479. "I2": "input",
  102480. "I3": "input",
  102481. "O": "output"
  102482. },
  102483. "connections": {
  102484. "I0": [ "0" ],
  102485. "I1": [ "0" ],
  102486. "I2": [ 2934 ],
  102487. "I3": [ 4521 ],
  102488. "O": [ 4614 ]
  102489. }
  102490. },
  102491. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102492. "hide_name": 0,
  102493. "type": "SB_LUT4",
  102494. "parameters": {
  102495. "LUT_INIT": "0110100110010110"
  102496. },
  102497. "attributes": {
  102498. "module_not_derived": "00000000000000000000000000000001",
  102499. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102500. },
  102501. "port_directions": {
  102502. "I0": "input",
  102503. "I1": "input",
  102504. "I2": "input",
  102505. "I3": "input",
  102506. "O": "output"
  102507. },
  102508. "connections": {
  102509. "I0": [ "0" ],
  102510. "I1": [ 4612 ],
  102511. "I2": [ "0" ],
  102512. "I3": [ 4611 ],
  102513. "O": [ 4491 ]
  102514. }
  102515. },
  102516. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  102517. "hide_name": 0,
  102518. "type": "SB_LUT4",
  102519. "parameters": {
  102520. "LUT_INIT": "0110100110010110"
  102521. },
  102522. "attributes": {
  102523. "module_not_derived": "00000000000000000000000000000001",
  102524. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102525. },
  102526. "port_directions": {
  102527. "I0": "input",
  102528. "I1": "input",
  102529. "I2": "input",
  102530. "I3": "input",
  102531. "O": "output"
  102532. },
  102533. "connections": {
  102534. "I0": [ "0" ],
  102535. "I1": [ 4592 ],
  102536. "I2": [ "0" ],
  102537. "I3": [ 4591 ],
  102538. "O": [ 4492 ]
  102539. }
  102540. },
  102541. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102542. "hide_name": 0,
  102543. "type": "SB_LUT4",
  102544. "parameters": {
  102545. "LUT_INIT": "0000111100000000"
  102546. },
  102547. "attributes": {
  102548. "module_not_derived": "00000000000000000000000000000001",
  102549. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102550. },
  102551. "port_directions": {
  102552. "I0": "input",
  102553. "I1": "input",
  102554. "I2": "input",
  102555. "I3": "input",
  102556. "O": "output"
  102557. },
  102558. "connections": {
  102559. "I0": [ "0" ],
  102560. "I1": [ "0" ],
  102561. "I2": [ 3668 ],
  102562. "I3": [ 4521 ],
  102563. "O": [ 4612 ]
  102564. }
  102565. },
  102566. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102567. "hide_name": 0,
  102568. "type": "SB_LUT4",
  102569. "parameters": {
  102570. "LUT_INIT": "0110100110010110"
  102571. },
  102572. "attributes": {
  102573. "module_not_derived": "00000000000000000000000000000001",
  102574. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102575. },
  102576. "port_directions": {
  102577. "I0": "input",
  102578. "I1": "input",
  102579. "I2": "input",
  102580. "I3": "input",
  102581. "O": "output"
  102582. },
  102583. "connections": {
  102584. "I0": [ "0" ],
  102585. "I1": [ 4610 ],
  102586. "I2": [ "0" ],
  102587. "I3": [ 4609 ],
  102588. "O": [ 4500 ]
  102589. }
  102590. },
  102591. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  102592. "hide_name": 0,
  102593. "type": "SB_LUT4",
  102594. "parameters": {
  102595. "LUT_INIT": "0110100110010110"
  102596. },
  102597. "attributes": {
  102598. "module_not_derived": "00000000000000000000000000000001",
  102599. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102600. },
  102601. "port_directions": {
  102602. "I0": "input",
  102603. "I1": "input",
  102604. "I2": "input",
  102605. "I3": "input",
  102606. "O": "output"
  102607. },
  102608. "connections": {
  102609. "I0": [ "0" ],
  102610. "I1": [ 4590 ],
  102611. "I2": [ "0" ],
  102612. "I3": [ 4589 ],
  102613. "O": [ 4501 ]
  102614. }
  102615. },
  102616. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102617. "hide_name": 0,
  102618. "type": "SB_LUT4",
  102619. "parameters": {
  102620. "LUT_INIT": "0000111100000000"
  102621. },
  102622. "attributes": {
  102623. "module_not_derived": "00000000000000000000000000000001",
  102624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102625. },
  102626. "port_directions": {
  102627. "I0": "input",
  102628. "I1": "input",
  102629. "I2": "input",
  102630. "I3": "input",
  102631. "O": "output"
  102632. },
  102633. "connections": {
  102634. "I0": [ "0" ],
  102635. "I1": [ "0" ],
  102636. "I2": [ 3666 ],
  102637. "I3": [ 4521 ],
  102638. "O": [ 4610 ]
  102639. }
  102640. },
  102641. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102642. "hide_name": 0,
  102643. "type": "SB_LUT4",
  102644. "parameters": {
  102645. "LUT_INIT": "0110100110010110"
  102646. },
  102647. "attributes": {
  102648. "module_not_derived": "00000000000000000000000000000001",
  102649. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102650. },
  102651. "port_directions": {
  102652. "I0": "input",
  102653. "I1": "input",
  102654. "I2": "input",
  102655. "I3": "input",
  102656. "O": "output"
  102657. },
  102658. "connections": {
  102659. "I0": [ "0" ],
  102660. "I1": [ 4608 ],
  102661. "I2": [ "0" ],
  102662. "I3": [ 4607 ],
  102663. "O": [ 4507 ]
  102664. }
  102665. },
  102666. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  102667. "hide_name": 0,
  102668. "type": "SB_LUT4",
  102669. "parameters": {
  102670. "LUT_INIT": "0110100110010110"
  102671. },
  102672. "attributes": {
  102673. "module_not_derived": "00000000000000000000000000000001",
  102674. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102675. },
  102676. "port_directions": {
  102677. "I0": "input",
  102678. "I1": "input",
  102679. "I2": "input",
  102680. "I3": "input",
  102681. "O": "output"
  102682. },
  102683. "connections": {
  102684. "I0": [ "0" ],
  102685. "I1": [ 4588 ],
  102686. "I2": [ "0" ],
  102687. "I3": [ 4587 ],
  102688. "O": [ 4508 ]
  102689. }
  102690. },
  102691. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102692. "hide_name": 0,
  102693. "type": "SB_LUT4",
  102694. "parameters": {
  102695. "LUT_INIT": "0000111100000000"
  102696. },
  102697. "attributes": {
  102698. "module_not_derived": "00000000000000000000000000000001",
  102699. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102700. },
  102701. "port_directions": {
  102702. "I0": "input",
  102703. "I1": "input",
  102704. "I2": "input",
  102705. "I3": "input",
  102706. "O": "output"
  102707. },
  102708. "connections": {
  102709. "I0": [ "0" ],
  102710. "I1": [ "0" ],
  102711. "I2": [ 2954 ],
  102712. "I3": [ 4521 ],
  102713. "O": [ 4608 ]
  102714. }
  102715. },
  102716. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102717. "hide_name": 0,
  102718. "type": "SB_LUT4",
  102719. "parameters": {
  102720. "LUT_INIT": "0110100110010110"
  102721. },
  102722. "attributes": {
  102723. "module_not_derived": "00000000000000000000000000000001",
  102724. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102725. },
  102726. "port_directions": {
  102727. "I0": "input",
  102728. "I1": "input",
  102729. "I2": "input",
  102730. "I3": "input",
  102731. "O": "output"
  102732. },
  102733. "connections": {
  102734. "I0": [ "0" ],
  102735. "I1": [ 4606 ],
  102736. "I2": [ "0" ],
  102737. "I3": [ 4605 ],
  102738. "O": [ 4514 ]
  102739. }
  102740. },
  102741. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  102742. "hide_name": 0,
  102743. "type": "SB_LUT4",
  102744. "parameters": {
  102745. "LUT_INIT": "0110100110010110"
  102746. },
  102747. "attributes": {
  102748. "module_not_derived": "00000000000000000000000000000001",
  102749. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102750. },
  102751. "port_directions": {
  102752. "I0": "input",
  102753. "I1": "input",
  102754. "I2": "input",
  102755. "I3": "input",
  102756. "O": "output"
  102757. },
  102758. "connections": {
  102759. "I0": [ "0" ],
  102760. "I1": [ 4586 ],
  102761. "I2": [ "0" ],
  102762. "I3": [ 4585 ],
  102763. "O": [ 4515 ]
  102764. }
  102765. },
  102766. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102767. "hide_name": 0,
  102768. "type": "SB_LUT4",
  102769. "parameters": {
  102770. "LUT_INIT": "0000111100000000"
  102771. },
  102772. "attributes": {
  102773. "module_not_derived": "00000000000000000000000000000001",
  102774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102775. },
  102776. "port_directions": {
  102777. "I0": "input",
  102778. "I1": "input",
  102779. "I2": "input",
  102780. "I3": "input",
  102781. "O": "output"
  102782. },
  102783. "connections": {
  102784. "I0": [ "0" ],
  102785. "I1": [ "0" ],
  102786. "I2": [ 3684 ],
  102787. "I3": [ 4521 ],
  102788. "O": [ 4606 ]
  102789. }
  102790. },
  102791. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102792. "hide_name": 0,
  102793. "type": "SB_LUT4",
  102794. "parameters": {
  102795. "LUT_INIT": "0110100110010110"
  102796. },
  102797. "attributes": {
  102798. "module_not_derived": "00000000000000000000000000000001",
  102799. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102800. },
  102801. "port_directions": {
  102802. "I0": "input",
  102803. "I1": "input",
  102804. "I2": "input",
  102805. "I3": "input",
  102806. "O": "output"
  102807. },
  102808. "connections": {
  102809. "I0": [ "0" ],
  102810. "I1": [ 4604 ],
  102811. "I2": [ "0" ],
  102812. "I3": [ 4603 ],
  102813. "O": [ 4615 ]
  102814. }
  102815. },
  102816. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2": {
  102817. "hide_name": 0,
  102818. "type": "SB_LUT4",
  102819. "parameters": {
  102820. "LUT_INIT": "1111110011000000"
  102821. },
  102822. "attributes": {
  102823. "module_not_derived": "00000000000000000000000000000001",
  102824. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  102825. },
  102826. "port_directions": {
  102827. "I0": "input",
  102828. "I1": "input",
  102829. "I2": "input",
  102830. "I3": "input",
  102831. "O": "output"
  102832. },
  102833. "connections": {
  102834. "I0": [ "0" ],
  102835. "I1": [ 4616 ],
  102836. "I2": [ 4615 ],
  102837. "I3": [ 4617 ],
  102838. "O": [ 4536 ]
  102839. }
  102840. },
  102841. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  102842. "hide_name": 0,
  102843. "type": "SB_LUT4",
  102844. "parameters": {
  102845. "LUT_INIT": "1100001100111100"
  102846. },
  102847. "attributes": {
  102848. "module_not_derived": "00000000000000000000000000000001",
  102849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  102850. },
  102851. "port_directions": {
  102852. "I0": "input",
  102853. "I1": "input",
  102854. "I2": "input",
  102855. "I3": "input",
  102856. "O": "output"
  102857. },
  102858. "connections": {
  102859. "I0": [ "0" ],
  102860. "I1": [ 4616 ],
  102861. "I2": [ 4615 ],
  102862. "I3": [ 4617 ],
  102863. "O": [ 4465 ]
  102864. }
  102865. },
  102866. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  102867. "hide_name": 0,
  102868. "type": "SB_LUT4",
  102869. "parameters": {
  102870. "LUT_INIT": "0110100110010110"
  102871. },
  102872. "attributes": {
  102873. "module_not_derived": "00000000000000000000000000000001",
  102874. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102875. },
  102876. "port_directions": {
  102877. "I0": "input",
  102878. "I1": "input",
  102879. "I2": "input",
  102880. "I3": "input",
  102881. "O": "output"
  102882. },
  102883. "connections": {
  102884. "I0": [ "0" ],
  102885. "I1": [ 4584 ],
  102886. "I2": [ "0" ],
  102887. "I3": [ 4583 ],
  102888. "O": [ 4617 ]
  102889. }
  102890. },
  102891. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  102892. "hide_name": 0,
  102893. "type": "SB_LUT4",
  102894. "parameters": {
  102895. "LUT_INIT": "0000111100000000"
  102896. },
  102897. "attributes": {
  102898. "module_not_derived": "00000000000000000000000000000001",
  102899. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  102900. },
  102901. "port_directions": {
  102902. "I0": "input",
  102903. "I1": "input",
  102904. "I2": "input",
  102905. "I3": "input",
  102906. "O": "output"
  102907. },
  102908. "connections": {
  102909. "I0": [ "0" ],
  102910. "I1": [ "0" ],
  102911. "I2": [ 3016 ],
  102912. "I3": [ 4521 ],
  102913. "O": [ 4604 ]
  102914. }
  102915. },
  102916. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  102917. "hide_name": 0,
  102918. "type": "SB_LUT4",
  102919. "parameters": {
  102920. "LUT_INIT": "0110100110010110"
  102921. },
  102922. "attributes": {
  102923. "module_not_derived": "00000000000000000000000000000001",
  102924. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  102925. },
  102926. "port_directions": {
  102927. "I0": "input",
  102928. "I1": "input",
  102929. "I2": "input",
  102930. "I3": "input",
  102931. "O": "output"
  102932. },
  102933. "connections": {
  102934. "I0": [ "0" ],
  102935. "I1": [ 4602 ],
  102936. "I2": [ "0" ],
  102937. "I3": [ 4601 ],
  102938. "O": [ 4618 ]
  102939. }
  102940. },
  102941. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2": {
  102942. "hide_name": 0,
  102943. "type": "SB_LUT4",
  102944. "parameters": {
  102945. "LUT_INIT": "1111110011000000"
  102946. },
  102947. "attributes": {
  102948. "module_not_derived": "00000000000000000000000000000001",
  102949. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  102950. },
  102951. "port_directions": {
  102952. "I0": "input",
  102953. "I1": "input",
  102954. "I2": "input",
  102955. "I3": "input",
  102956. "O": "output"
  102957. },
  102958. "connections": {
  102959. "I0": [ "0" ],
  102960. "I1": [ 4619 ],
  102961. "I2": [ 4618 ],
  102962. "I3": [ 4620 ],
  102963. "O": [ 4540 ]
  102964. }
  102965. },
  102966. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  102967. "hide_name": 0,
  102968. "type": "SB_LUT4",
  102969. "parameters": {
  102970. "LUT_INIT": "1100001100111100"
  102971. },
  102972. "attributes": {
  102973. "module_not_derived": "00000000000000000000000000000001",
  102974. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  102975. },
  102976. "port_directions": {
  102977. "I0": "input",
  102978. "I1": "input",
  102979. "I2": "input",
  102980. "I3": "input",
  102981. "O": "output"
  102982. },
  102983. "connections": {
  102984. "I0": [ "0" ],
  102985. "I1": [ 4619 ],
  102986. "I2": [ 4618 ],
  102987. "I3": [ 4620 ],
  102988. "O": [ 4535 ]
  102989. }
  102990. },
  102991. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  102992. "hide_name": 0,
  102993. "type": "SB_LUT4",
  102994. "parameters": {
  102995. "LUT_INIT": "0110100110010110"
  102996. },
  102997. "attributes": {
  102998. "module_not_derived": "00000000000000000000000000000001",
  102999. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103000. },
  103001. "port_directions": {
  103002. "I0": "input",
  103003. "I1": "input",
  103004. "I2": "input",
  103005. "I3": "input",
  103006. "O": "output"
  103007. },
  103008. "connections": {
  103009. "I0": [ "0" ],
  103010. "I1": [ 4582 ],
  103011. "I2": [ "0" ],
  103012. "I3": [ 4581 ],
  103013. "O": [ 4620 ]
  103014. }
  103015. },
  103016. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  103017. "hide_name": 0,
  103018. "type": "SB_LUT4",
  103019. "parameters": {
  103020. "LUT_INIT": "0000111100000000"
  103021. },
  103022. "attributes": {
  103023. "module_not_derived": "00000000000000000000000000000001",
  103024. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103025. },
  103026. "port_directions": {
  103027. "I0": "input",
  103028. "I1": "input",
  103029. "I2": "input",
  103030. "I3": "input",
  103031. "O": "output"
  103032. },
  103033. "connections": {
  103034. "I0": [ "0" ],
  103035. "I1": [ "0" ],
  103036. "I2": [ 3643 ],
  103037. "I3": [ 4521 ],
  103038. "O": [ 4602 ]
  103039. }
  103040. },
  103041. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  103042. "hide_name": 0,
  103043. "type": "SB_LUT4",
  103044. "parameters": {
  103045. "LUT_INIT": "0110100110010110"
  103046. },
  103047. "attributes": {
  103048. "module_not_derived": "00000000000000000000000000000001",
  103049. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103050. },
  103051. "port_directions": {
  103052. "I0": "input",
  103053. "I1": "input",
  103054. "I2": "input",
  103055. "I3": "input",
  103056. "O": "output"
  103057. },
  103058. "connections": {
  103059. "I0": [ "0" ],
  103060. "I1": [ 4600 ],
  103061. "I2": [ "0" ],
  103062. "I3": [ 4599 ],
  103063. "O": [ 4621 ]
  103064. }
  103065. },
  103066. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2": {
  103067. "hide_name": 0,
  103068. "type": "SB_LUT4",
  103069. "parameters": {
  103070. "LUT_INIT": "1111110011000000"
  103071. },
  103072. "attributes": {
  103073. "module_not_derived": "00000000000000000000000000000001",
  103074. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103075. },
  103076. "port_directions": {
  103077. "I0": "input",
  103078. "I1": "input",
  103079. "I2": "input",
  103080. "I3": "input",
  103081. "O": "output"
  103082. },
  103083. "connections": {
  103084. "I0": [ "0" ],
  103085. "I1": [ 4622 ],
  103086. "I2": [ 4621 ],
  103087. "I3": [ 4623 ],
  103088. "O": [ 4544 ]
  103089. }
  103090. },
  103091. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  103092. "hide_name": 0,
  103093. "type": "SB_LUT4",
  103094. "parameters": {
  103095. "LUT_INIT": "1100001100111100"
  103096. },
  103097. "attributes": {
  103098. "module_not_derived": "00000000000000000000000000000001",
  103099. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103100. },
  103101. "port_directions": {
  103102. "I0": "input",
  103103. "I1": "input",
  103104. "I2": "input",
  103105. "I3": "input",
  103106. "O": "output"
  103107. },
  103108. "connections": {
  103109. "I0": [ "0" ],
  103110. "I1": [ 4622 ],
  103111. "I2": [ 4621 ],
  103112. "I3": [ 4623 ],
  103113. "O": [ 4539 ]
  103114. }
  103115. },
  103116. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  103117. "hide_name": 0,
  103118. "type": "SB_LUT4",
  103119. "parameters": {
  103120. "LUT_INIT": "0110100110010110"
  103121. },
  103122. "attributes": {
  103123. "module_not_derived": "00000000000000000000000000000001",
  103124. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103125. },
  103126. "port_directions": {
  103127. "I0": "input",
  103128. "I1": "input",
  103129. "I2": "input",
  103130. "I3": "input",
  103131. "O": "output"
  103132. },
  103133. "connections": {
  103134. "I0": [ "0" ],
  103135. "I1": [ 4580 ],
  103136. "I2": [ "0" ],
  103137. "I3": [ 4579 ],
  103138. "O": [ 4623 ]
  103139. }
  103140. },
  103141. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  103142. "hide_name": 0,
  103143. "type": "SB_LUT4",
  103144. "parameters": {
  103145. "LUT_INIT": "0000111100000000"
  103146. },
  103147. "attributes": {
  103148. "module_not_derived": "00000000000000000000000000000001",
  103149. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103150. },
  103151. "port_directions": {
  103152. "I0": "input",
  103153. "I1": "input",
  103154. "I2": "input",
  103155. "I3": "input",
  103156. "O": "output"
  103157. },
  103158. "connections": {
  103159. "I0": [ "0" ],
  103160. "I1": [ "0" ],
  103161. "I2": [ 3647 ],
  103162. "I3": [ 4521 ],
  103163. "O": [ 4600 ]
  103164. }
  103165. },
  103166. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  103167. "hide_name": 0,
  103168. "type": "SB_LUT4",
  103169. "parameters": {
  103170. "LUT_INIT": "0110100110010110"
  103171. },
  103172. "attributes": {
  103173. "module_not_derived": "00000000000000000000000000000001",
  103174. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103175. },
  103176. "port_directions": {
  103177. "I0": "input",
  103178. "I1": "input",
  103179. "I2": "input",
  103180. "I3": "input",
  103181. "O": "output"
  103182. },
  103183. "connections": {
  103184. "I0": [ "0" ],
  103185. "I1": [ 4598 ],
  103186. "I2": [ "0" ],
  103187. "I3": [ 4597 ],
  103188. "O": [ 4624 ]
  103189. }
  103190. },
  103191. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2": {
  103192. "hide_name": 0,
  103193. "type": "SB_LUT4",
  103194. "parameters": {
  103195. "LUT_INIT": "1111110011000000"
  103196. },
  103197. "attributes": {
  103198. "module_not_derived": "00000000000000000000000000000001",
  103199. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103200. },
  103201. "port_directions": {
  103202. "I0": "input",
  103203. "I1": "input",
  103204. "I2": "input",
  103205. "I3": "input",
  103206. "O": "output"
  103207. },
  103208. "connections": {
  103209. "I0": [ "0" ],
  103210. "I1": [ 4625 ],
  103211. "I2": [ 4624 ],
  103212. "I3": [ 4626 ],
  103213. "O": [ 4548 ]
  103214. }
  103215. },
  103216. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  103217. "hide_name": 0,
  103218. "type": "SB_LUT4",
  103219. "parameters": {
  103220. "LUT_INIT": "1100001100111100"
  103221. },
  103222. "attributes": {
  103223. "module_not_derived": "00000000000000000000000000000001",
  103224. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103225. },
  103226. "port_directions": {
  103227. "I0": "input",
  103228. "I1": "input",
  103229. "I2": "input",
  103230. "I3": "input",
  103231. "O": "output"
  103232. },
  103233. "connections": {
  103234. "I0": [ "0" ],
  103235. "I1": [ 4625 ],
  103236. "I2": [ 4624 ],
  103237. "I3": [ 4626 ],
  103238. "O": [ 4543 ]
  103239. }
  103240. },
  103241. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  103242. "hide_name": 0,
  103243. "type": "SB_LUT4",
  103244. "parameters": {
  103245. "LUT_INIT": "0110100110010110"
  103246. },
  103247. "attributes": {
  103248. "module_not_derived": "00000000000000000000000000000001",
  103249. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103250. },
  103251. "port_directions": {
  103252. "I0": "input",
  103253. "I1": "input",
  103254. "I2": "input",
  103255. "I3": "input",
  103256. "O": "output"
  103257. },
  103258. "connections": {
  103259. "I0": [ "0" ],
  103260. "I1": [ 4578 ],
  103261. "I2": [ "0" ],
  103262. "I3": [ 4577 ],
  103263. "O": [ 4626 ]
  103264. }
  103265. },
  103266. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  103267. "hide_name": 0,
  103268. "type": "SB_LUT4",
  103269. "parameters": {
  103270. "LUT_INIT": "0000111100000000"
  103271. },
  103272. "attributes": {
  103273. "module_not_derived": "00000000000000000000000000000001",
  103274. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103275. },
  103276. "port_directions": {
  103277. "I0": "input",
  103278. "I1": "input",
  103279. "I2": "input",
  103280. "I3": "input",
  103281. "O": "output"
  103282. },
  103283. "connections": {
  103284. "I0": [ "0" ],
  103285. "I1": [ "0" ],
  103286. "I2": [ 2996 ],
  103287. "I3": [ 4521 ],
  103288. "O": [ 4598 ]
  103289. }
  103290. },
  103291. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1": {
  103292. "hide_name": 0,
  103293. "type": "SB_LUT4",
  103294. "parameters": {
  103295. "LUT_INIT": "0110100110010110"
  103296. },
  103297. "attributes": {
  103298. "module_not_derived": "00000000000000000000000000000001",
  103299. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103300. },
  103301. "port_directions": {
  103302. "I0": "input",
  103303. "I1": "input",
  103304. "I2": "input",
  103305. "I3": "input",
  103306. "O": "output"
  103307. },
  103308. "connections": {
  103309. "I0": [ "0" ],
  103310. "I1": [ 4596 ],
  103311. "I2": [ "0" ],
  103312. "I3": [ 4595 ],
  103313. "O": [ 4627 ]
  103314. }
  103315. },
  103316. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2": {
  103317. "hide_name": 0,
  103318. "type": "SB_LUT4",
  103319. "parameters": {
  103320. "LUT_INIT": "1111110011000000"
  103321. },
  103322. "attributes": {
  103323. "module_not_derived": "00000000000000000000000000000001",
  103324. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103325. },
  103326. "port_directions": {
  103327. "I0": "input",
  103328. "I1": "input",
  103329. "I2": "input",
  103330. "I3": "input",
  103331. "O": "output"
  103332. },
  103333. "connections": {
  103334. "I0": [ "0" ],
  103335. "I1": [ 4628 ],
  103336. "I2": [ 4627 ],
  103337. "I3": [ 4629 ],
  103338. "O": [ 4552 ]
  103339. }
  103340. },
  103341. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2_1": {
  103342. "hide_name": 0,
  103343. "type": "SB_LUT4",
  103344. "parameters": {
  103345. "LUT_INIT": "1100001100111100"
  103346. },
  103347. "attributes": {
  103348. "module_not_derived": "00000000000000000000000000000001",
  103349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103350. },
  103351. "port_directions": {
  103352. "I0": "input",
  103353. "I1": "input",
  103354. "I2": "input",
  103355. "I3": "input",
  103356. "O": "output"
  103357. },
  103358. "connections": {
  103359. "I0": [ "0" ],
  103360. "I1": [ 4628 ],
  103361. "I2": [ 4627 ],
  103362. "I3": [ 4629 ],
  103363. "O": [ 4547 ]
  103364. }
  103365. },
  103366. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  103367. "hide_name": 0,
  103368. "type": "SB_LUT4",
  103369. "parameters": {
  103370. "LUT_INIT": "0110100110010110"
  103371. },
  103372. "attributes": {
  103373. "module_not_derived": "00000000000000000000000000000001",
  103374. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103375. },
  103376. "port_directions": {
  103377. "I0": "input",
  103378. "I1": "input",
  103379. "I2": "input",
  103380. "I3": "input",
  103381. "O": "output"
  103382. },
  103383. "connections": {
  103384. "I0": [ "0" ],
  103385. "I1": [ 4576 ],
  103386. "I2": [ "0" ],
  103387. "I3": [ 4575 ],
  103388. "O": [ 4629 ]
  103389. }
  103390. },
  103391. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_O": {
  103392. "hide_name": 0,
  103393. "type": "SB_LUT4",
  103394. "parameters": {
  103395. "LUT_INIT": "0000111100000000"
  103396. },
  103397. "attributes": {
  103398. "module_not_derived": "00000000000000000000000000000001",
  103399. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103400. },
  103401. "port_directions": {
  103402. "I0": "input",
  103403. "I1": "input",
  103404. "I2": "input",
  103405. "I3": "input",
  103406. "O": "output"
  103407. },
  103408. "connections": {
  103409. "I0": [ "0" ],
  103410. "I1": [ "0" ],
  103411. "I2": [ 3654 ],
  103412. "I3": [ 4521 ],
  103413. "O": [ 4596 ]
  103414. }
  103415. },
  103416. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_LUT4_I1": {
  103417. "hide_name": 0,
  103418. "type": "SB_LUT4",
  103419. "parameters": {
  103420. "LUT_INIT": "0110100110010110"
  103421. },
  103422. "attributes": {
  103423. "module_not_derived": "00000000000000000000000000000001",
  103424. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103425. },
  103426. "port_directions": {
  103427. "I0": "input",
  103428. "I1": "input",
  103429. "I2": "input",
  103430. "I3": "input",
  103431. "O": "output"
  103432. },
  103433. "connections": {
  103434. "I0": [ "0" ],
  103435. "I1": [ 4594 ],
  103436. "I2": [ "0" ],
  103437. "I3": [ 4593 ],
  103438. "O": [ 4570 ]
  103439. }
  103440. },
  103441. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_I2": {
  103442. "hide_name": 0,
  103443. "type": "SB_LUT4",
  103444. "parameters": {
  103445. "LUT_INIT": "1100001100111100"
  103446. },
  103447. "attributes": {
  103448. "module_not_derived": "00000000000000000000000000000001",
  103449. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  103450. },
  103451. "port_directions": {
  103452. "I0": "input",
  103453. "I1": "input",
  103454. "I2": "input",
  103455. "I3": "input",
  103456. "O": "output"
  103457. },
  103458. "connections": {
  103459. "I0": [ "0" ],
  103460. "I1": [ 4569 ],
  103461. "I2": [ 4570 ],
  103462. "I3": [ 4571 ],
  103463. "O": [ 4551 ]
  103464. }
  103465. },
  103466. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_LUT4_I1_O_SB_LUT4_O": {
  103467. "hide_name": 0,
  103468. "type": "SB_LUT4",
  103469. "parameters": {
  103470. "LUT_INIT": "0110100110010110"
  103471. },
  103472. "attributes": {
  103473. "module_not_derived": "00000000000000000000000000000001",
  103474. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103475. },
  103476. "port_directions": {
  103477. "I0": "input",
  103478. "I1": "input",
  103479. "I2": "input",
  103480. "I3": "input",
  103481. "O": "output"
  103482. },
  103483. "connections": {
  103484. "I0": [ "0" ],
  103485. "I1": [ 4574 ],
  103486. "I2": [ "0" ],
  103487. "I3": [ 4573 ],
  103488. "O": [ 4571 ]
  103489. }
  103490. },
  103491. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_LUT4_O": {
  103492. "hide_name": 0,
  103493. "type": "SB_LUT4",
  103494. "parameters": {
  103495. "LUT_INIT": "0000111100000000"
  103496. },
  103497. "attributes": {
  103498. "module_not_derived": "00000000000000000000000000000001",
  103499. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103500. },
  103501. "port_directions": {
  103502. "I0": "input",
  103503. "I1": "input",
  103504. "I2": "input",
  103505. "I3": "input",
  103506. "O": "output"
  103507. },
  103508. "connections": {
  103509. "I0": [ "0" ],
  103510. "I1": [ "0" ],
  103511. "I2": [ 3658 ],
  103512. "I3": [ 4521 ],
  103513. "O": [ 4594 ]
  103514. }
  103515. },
  103516. "cpu_I.execute_MUL_HH_SB_LUT4_O_I3_SB_CARRY_CO": {
  103517. "hide_name": 0,
  103518. "type": "SB_CARRY",
  103519. "parameters": {
  103520. },
  103521. "attributes": {
  103522. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103523. },
  103524. "port_directions": {
  103525. "CI": "input",
  103526. "CO": "output",
  103527. "I0": "input",
  103528. "I1": "input"
  103529. },
  103530. "connections": {
  103531. "CI": [ 4553 ],
  103532. "CO": [ 4463 ],
  103533. "I0": [ 4551 ],
  103534. "I1": [ 4552 ]
  103535. }
  103536. },
  103537. "cpu_I.execute_MUL_HL_SB_LUT4_O": {
  103538. "hide_name": 0,
  103539. "type": "SB_LUT4",
  103540. "parameters": {
  103541. "LUT_INIT": "0110100110010110"
  103542. },
  103543. "attributes": {
  103544. "module_not_derived": "00000000000000000000000000000001",
  103545. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103546. },
  103547. "port_directions": {
  103548. "I0": "input",
  103549. "I1": "input",
  103550. "I2": "input",
  103551. "I3": "input",
  103552. "O": "output"
  103553. },
  103554. "connections": {
  103555. "I0": [ "0" ],
  103556. "I1": [ "0" ],
  103557. "I2": [ 4521 ],
  103558. "I3": [ 4630 ],
  103559. "O": [ 4631 ]
  103560. }
  103561. },
  103562. "cpu_I.execute_MUL_HL_SB_LUT4_O_1": {
  103563. "hide_name": 0,
  103564. "type": "SB_LUT4",
  103565. "parameters": {
  103566. "LUT_INIT": "0110100110010110"
  103567. },
  103568. "attributes": {
  103569. "module_not_derived": "00000000000000000000000000000001",
  103570. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103571. },
  103572. "port_directions": {
  103573. "I0": "input",
  103574. "I1": "input",
  103575. "I2": "input",
  103576. "I3": "input",
  103577. "O": "output"
  103578. },
  103579. "connections": {
  103580. "I0": [ "0" ],
  103581. "I1": [ 4632 ],
  103582. "I2": [ 4633 ],
  103583. "I3": [ 4634 ],
  103584. "O": [ 4635 ]
  103585. }
  103586. },
  103587. "cpu_I.execute_MUL_HL_SB_LUT4_O_10": {
  103588. "hide_name": 0,
  103589. "type": "SB_LUT4",
  103590. "parameters": {
  103591. "LUT_INIT": "0110100110010110"
  103592. },
  103593. "attributes": {
  103594. "module_not_derived": "00000000000000000000000000000001",
  103595. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103596. },
  103597. "port_directions": {
  103598. "I0": "input",
  103599. "I1": "input",
  103600. "I2": "input",
  103601. "I3": "input",
  103602. "O": "output"
  103603. },
  103604. "connections": {
  103605. "I0": [ "0" ],
  103606. "I1": [ 4636 ],
  103607. "I2": [ 4637 ],
  103608. "I3": [ 4638 ],
  103609. "O": [ 4639 ]
  103610. }
  103611. },
  103612. "cpu_I.execute_MUL_HL_SB_LUT4_O_10_I2_SB_LUT4_O": {
  103613. "hide_name": 0,
  103614. "type": "SB_LUT4",
  103615. "parameters": {
  103616. "LUT_INIT": "0000111100000000"
  103617. },
  103618. "attributes": {
  103619. "module_not_derived": "00000000000000000000000000000001",
  103620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103621. },
  103622. "port_directions": {
  103623. "I0": "input",
  103624. "I1": "input",
  103625. "I2": "input",
  103626. "I3": "input",
  103627. "O": "output"
  103628. },
  103629. "connections": {
  103630. "I0": [ "0" ],
  103631. "I1": [ "0" ],
  103632. "I2": [ 2535 ],
  103633. "I3": [ 4521 ],
  103634. "O": [ 4637 ]
  103635. }
  103636. },
  103637. "cpu_I.execute_MUL_HL_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  103638. "hide_name": 0,
  103639. "type": "SB_CARRY",
  103640. "parameters": {
  103641. },
  103642. "attributes": {
  103643. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103644. },
  103645. "port_directions": {
  103646. "CI": "input",
  103647. "CO": "output",
  103648. "I0": "input",
  103649. "I1": "input"
  103650. },
  103651. "connections": {
  103652. "CI": [ 4640 ],
  103653. "CO": [ 4638 ],
  103654. "I0": [ 4641 ],
  103655. "I1": [ 4521 ]
  103656. }
  103657. },
  103658. "cpu_I.execute_MUL_HL_SB_LUT4_O_11": {
  103659. "hide_name": 0,
  103660. "type": "SB_LUT4",
  103661. "parameters": {
  103662. "LUT_INIT": "0110100110010110"
  103663. },
  103664. "attributes": {
  103665. "module_not_derived": "00000000000000000000000000000001",
  103666. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103667. },
  103668. "port_directions": {
  103669. "I0": "input",
  103670. "I1": "input",
  103671. "I2": "input",
  103672. "I3": "input",
  103673. "O": "output"
  103674. },
  103675. "connections": {
  103676. "I0": [ "0" ],
  103677. "I1": [ 4642 ],
  103678. "I2": [ 4643 ],
  103679. "I3": [ 4644 ],
  103680. "O": [ 4645 ]
  103681. }
  103682. },
  103683. "cpu_I.execute_MUL_HL_SB_LUT4_O_11_I2_SB_LUT4_O": {
  103684. "hide_name": 0,
  103685. "type": "SB_LUT4",
  103686. "parameters": {
  103687. "LUT_INIT": "0000111100000000"
  103688. },
  103689. "attributes": {
  103690. "module_not_derived": "00000000000000000000000000000001",
  103691. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103692. },
  103693. "port_directions": {
  103694. "I0": "input",
  103695. "I1": "input",
  103696. "I2": "input",
  103697. "I3": "input",
  103698. "O": "output"
  103699. },
  103700. "connections": {
  103701. "I0": [ "0" ],
  103702. "I1": [ "0" ],
  103703. "I2": [ 3646 ],
  103704. "I3": [ 4521 ],
  103705. "O": [ 4643 ]
  103706. }
  103707. },
  103708. "cpu_I.execute_MUL_HL_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  103709. "hide_name": 0,
  103710. "type": "SB_CARRY",
  103711. "parameters": {
  103712. },
  103713. "attributes": {
  103714. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103715. },
  103716. "port_directions": {
  103717. "CI": "input",
  103718. "CO": "output",
  103719. "I0": "input",
  103720. "I1": "input"
  103721. },
  103722. "connections": {
  103723. "CI": [ 4638 ],
  103724. "CO": [ 4644 ],
  103725. "I0": [ 4636 ],
  103726. "I1": [ 4637 ]
  103727. }
  103728. },
  103729. "cpu_I.execute_MUL_HL_SB_LUT4_O_12": {
  103730. "hide_name": 0,
  103731. "type": "SB_LUT4",
  103732. "parameters": {
  103733. "LUT_INIT": "0110100110010110"
  103734. },
  103735. "attributes": {
  103736. "module_not_derived": "00000000000000000000000000000001",
  103737. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103738. },
  103739. "port_directions": {
  103740. "I0": "input",
  103741. "I1": "input",
  103742. "I2": "input",
  103743. "I3": "input",
  103744. "O": "output"
  103745. },
  103746. "connections": {
  103747. "I0": [ "0" ],
  103748. "I1": [ 4646 ],
  103749. "I2": [ 4647 ],
  103750. "I3": [ 4648 ],
  103751. "O": [ 4649 ]
  103752. }
  103753. },
  103754. "cpu_I.execute_MUL_HL_SB_LUT4_O_12_I2_SB_LUT4_O": {
  103755. "hide_name": 0,
  103756. "type": "SB_LUT4",
  103757. "parameters": {
  103758. "LUT_INIT": "0000111100000000"
  103759. },
  103760. "attributes": {
  103761. "module_not_derived": "00000000000000000000000000000001",
  103762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103763. },
  103764. "port_directions": {
  103765. "I0": "input",
  103766. "I1": "input",
  103767. "I2": "input",
  103768. "I3": "input",
  103769. "O": "output"
  103770. },
  103771. "connections": {
  103772. "I0": [ "0" ],
  103773. "I1": [ "0" ],
  103774. "I2": [ 3650 ],
  103775. "I3": [ 4521 ],
  103776. "O": [ 4647 ]
  103777. }
  103778. },
  103779. "cpu_I.execute_MUL_HL_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  103780. "hide_name": 0,
  103781. "type": "SB_CARRY",
  103782. "parameters": {
  103783. },
  103784. "attributes": {
  103785. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103786. },
  103787. "port_directions": {
  103788. "CI": "input",
  103789. "CO": "output",
  103790. "I0": "input",
  103791. "I1": "input"
  103792. },
  103793. "connections": {
  103794. "CI": [ 4644 ],
  103795. "CO": [ 4648 ],
  103796. "I0": [ 4642 ],
  103797. "I1": [ 4643 ]
  103798. }
  103799. },
  103800. "cpu_I.execute_MUL_HL_SB_LUT4_O_13": {
  103801. "hide_name": 0,
  103802. "type": "SB_LUT4",
  103803. "parameters": {
  103804. "LUT_INIT": "0110100110010110"
  103805. },
  103806. "attributes": {
  103807. "module_not_derived": "00000000000000000000000000000001",
  103808. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103809. },
  103810. "port_directions": {
  103811. "I0": "input",
  103812. "I1": "input",
  103813. "I2": "input",
  103814. "I3": "input",
  103815. "O": "output"
  103816. },
  103817. "connections": {
  103818. "I0": [ "0" ],
  103819. "I1": [ 4650 ],
  103820. "I2": [ 4651 ],
  103821. "I3": [ 4652 ],
  103822. "O": [ 4653 ]
  103823. }
  103824. },
  103825. "cpu_I.execute_MUL_HL_SB_LUT4_O_13_I2_SB_LUT4_O": {
  103826. "hide_name": 0,
  103827. "type": "SB_LUT4",
  103828. "parameters": {
  103829. "LUT_INIT": "0000111100000000"
  103830. },
  103831. "attributes": {
  103832. "module_not_derived": "00000000000000000000000000000001",
  103833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103834. },
  103835. "port_directions": {
  103836. "I0": "input",
  103837. "I1": "input",
  103838. "I2": "input",
  103839. "I3": "input",
  103840. "O": "output"
  103841. },
  103842. "connections": {
  103843. "I0": [ "0" ],
  103844. "I1": [ "0" ],
  103845. "I2": [ 3653 ],
  103846. "I3": [ 4521 ],
  103847. "O": [ 4651 ]
  103848. }
  103849. },
  103850. "cpu_I.execute_MUL_HL_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  103851. "hide_name": 0,
  103852. "type": "SB_CARRY",
  103853. "parameters": {
  103854. },
  103855. "attributes": {
  103856. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103857. },
  103858. "port_directions": {
  103859. "CI": "input",
  103860. "CO": "output",
  103861. "I0": "input",
  103862. "I1": "input"
  103863. },
  103864. "connections": {
  103865. "CI": [ 4648 ],
  103866. "CO": [ 4652 ],
  103867. "I0": [ 4646 ],
  103868. "I1": [ 4647 ]
  103869. }
  103870. },
  103871. "cpu_I.execute_MUL_HL_SB_LUT4_O_14": {
  103872. "hide_name": 0,
  103873. "type": "SB_LUT4",
  103874. "parameters": {
  103875. "LUT_INIT": "0110100110010110"
  103876. },
  103877. "attributes": {
  103878. "module_not_derived": "00000000000000000000000000000001",
  103879. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103880. },
  103881. "port_directions": {
  103882. "I0": "input",
  103883. "I1": "input",
  103884. "I2": "input",
  103885. "I3": "input",
  103886. "O": "output"
  103887. },
  103888. "connections": {
  103889. "I0": [ "0" ],
  103890. "I1": [ 4654 ],
  103891. "I2": [ 4655 ],
  103892. "I3": [ 4656 ],
  103893. "O": [ 4657 ]
  103894. }
  103895. },
  103896. "cpu_I.execute_MUL_HL_SB_LUT4_O_14_I2_SB_LUT4_O": {
  103897. "hide_name": 0,
  103898. "type": "SB_LUT4",
  103899. "parameters": {
  103900. "LUT_INIT": "0000111100000000"
  103901. },
  103902. "attributes": {
  103903. "module_not_derived": "00000000000000000000000000000001",
  103904. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103905. },
  103906. "port_directions": {
  103907. "I0": "input",
  103908. "I1": "input",
  103909. "I2": "input",
  103910. "I3": "input",
  103911. "O": "output"
  103912. },
  103913. "connections": {
  103914. "I0": [ "0" ],
  103915. "I1": [ "0" ],
  103916. "I2": [ 3022 ],
  103917. "I3": [ 4521 ],
  103918. "O": [ 4655 ]
  103919. }
  103920. },
  103921. "cpu_I.execute_MUL_HL_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  103922. "hide_name": 0,
  103923. "type": "SB_CARRY",
  103924. "parameters": {
  103925. },
  103926. "attributes": {
  103927. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103928. },
  103929. "port_directions": {
  103930. "CI": "input",
  103931. "CO": "output",
  103932. "I0": "input",
  103933. "I1": "input"
  103934. },
  103935. "connections": {
  103936. "CI": [ 4652 ],
  103937. "CO": [ 4656 ],
  103938. "I0": [ 4650 ],
  103939. "I1": [ 4651 ]
  103940. }
  103941. },
  103942. "cpu_I.execute_MUL_HL_SB_LUT4_O_15": {
  103943. "hide_name": 0,
  103944. "type": "SB_LUT4",
  103945. "parameters": {
  103946. "LUT_INIT": "0110100110010110"
  103947. },
  103948. "attributes": {
  103949. "module_not_derived": "00000000000000000000000000000001",
  103950. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  103951. },
  103952. "port_directions": {
  103953. "I0": "input",
  103954. "I1": "input",
  103955. "I2": "input",
  103956. "I3": "input",
  103957. "O": "output"
  103958. },
  103959. "connections": {
  103960. "I0": [ "0" ],
  103961. "I1": [ 4658 ],
  103962. "I2": [ 4659 ],
  103963. "I3": [ 4660 ],
  103964. "O": [ 4661 ]
  103965. }
  103966. },
  103967. "cpu_I.execute_MUL_HL_SB_LUT4_O_15_I2_SB_LUT4_O": {
  103968. "hide_name": 0,
  103969. "type": "SB_LUT4",
  103970. "parameters": {
  103971. "LUT_INIT": "0000111100000000"
  103972. },
  103973. "attributes": {
  103974. "module_not_derived": "00000000000000000000000000000001",
  103975. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  103976. },
  103977. "port_directions": {
  103978. "I0": "input",
  103979. "I1": "input",
  103980. "I2": "input",
  103981. "I3": "input",
  103982. "O": "output"
  103983. },
  103984. "connections": {
  103985. "I0": [ "0" ],
  103986. "I1": [ "0" ],
  103987. "I2": [ 3047 ],
  103988. "I3": [ 4521 ],
  103989. "O": [ 4659 ]
  103990. }
  103991. },
  103992. "cpu_I.execute_MUL_HL_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  103993. "hide_name": 0,
  103994. "type": "SB_CARRY",
  103995. "parameters": {
  103996. },
  103997. "attributes": {
  103998. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  103999. },
  104000. "port_directions": {
  104001. "CI": "input",
  104002. "CO": "output",
  104003. "I0": "input",
  104004. "I1": "input"
  104005. },
  104006. "connections": {
  104007. "CI": [ 4634 ],
  104008. "CO": [ 4660 ],
  104009. "I0": [ 4632 ],
  104010. "I1": [ 4633 ]
  104011. }
  104012. },
  104013. "cpu_I.execute_MUL_HL_SB_LUT4_O_16": {
  104014. "hide_name": 0,
  104015. "type": "SB_LUT4",
  104016. "parameters": {
  104017. "LUT_INIT": "0110100110010110"
  104018. },
  104019. "attributes": {
  104020. "module_not_derived": "00000000000000000000000000000001",
  104021. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104022. },
  104023. "port_directions": {
  104024. "I0": "input",
  104025. "I1": "input",
  104026. "I2": "input",
  104027. "I3": "input",
  104028. "O": "output"
  104029. },
  104030. "connections": {
  104031. "I0": [ "0" ],
  104032. "I1": [ 4662 ],
  104033. "I2": [ 4663 ],
  104034. "I3": [ 4664 ],
  104035. "O": [ 4665 ]
  104036. }
  104037. },
  104038. "cpu_I.execute_MUL_HL_SB_LUT4_O_16_I2_SB_LUT4_O": {
  104039. "hide_name": 0,
  104040. "type": "SB_LUT4",
  104041. "parameters": {
  104042. "LUT_INIT": "0000111100000000"
  104043. },
  104044. "attributes": {
  104045. "module_not_derived": "00000000000000000000000000000001",
  104046. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104047. },
  104048. "port_directions": {
  104049. "I0": "input",
  104050. "I1": "input",
  104051. "I2": "input",
  104052. "I3": "input",
  104053. "O": "output"
  104054. },
  104055. "connections": {
  104056. "I0": [ "0" ],
  104057. "I1": [ "0" ],
  104058. "I2": [ 3061 ],
  104059. "I3": [ 4521 ],
  104060. "O": [ 4663 ]
  104061. }
  104062. },
  104063. "cpu_I.execute_MUL_HL_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  104064. "hide_name": 0,
  104065. "type": "SB_CARRY",
  104066. "parameters": {
  104067. },
  104068. "attributes": {
  104069. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104070. },
  104071. "port_directions": {
  104072. "CI": "input",
  104073. "CO": "output",
  104074. "I0": "input",
  104075. "I1": "input"
  104076. },
  104077. "connections": {
  104078. "CI": [ 4660 ],
  104079. "CO": [ 4664 ],
  104080. "I0": [ 4658 ],
  104081. "I1": [ 4659 ]
  104082. }
  104083. },
  104084. "cpu_I.execute_MUL_HL_SB_LUT4_O_1_I2_SB_LUT4_O": {
  104085. "hide_name": 0,
  104086. "type": "SB_LUT4",
  104087. "parameters": {
  104088. "LUT_INIT": "0000111100000000"
  104089. },
  104090. "attributes": {
  104091. "module_not_derived": "00000000000000000000000000000001",
  104092. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104093. },
  104094. "port_directions": {
  104095. "I0": "input",
  104096. "I1": "input",
  104097. "I2": "input",
  104098. "I3": "input",
  104099. "O": "output"
  104100. },
  104101. "connections": {
  104102. "I0": [ "0" ],
  104103. "I1": [ "0" ],
  104104. "I2": [ 3036 ],
  104105. "I3": [ 4521 ],
  104106. "O": [ 4633 ]
  104107. }
  104108. },
  104109. "cpu_I.execute_MUL_HL_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  104110. "hide_name": 0,
  104111. "type": "SB_CARRY",
  104112. "parameters": {
  104113. },
  104114. "attributes": {
  104115. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104116. },
  104117. "port_directions": {
  104118. "CI": "input",
  104119. "CO": "output",
  104120. "I0": "input",
  104121. "I1": "input"
  104122. },
  104123. "connections": {
  104124. "CI": [ 4656 ],
  104125. "CO": [ 4634 ],
  104126. "I0": [ 4654 ],
  104127. "I1": [ 4655 ]
  104128. }
  104129. },
  104130. "cpu_I.execute_MUL_HL_SB_LUT4_O_2": {
  104131. "hide_name": 0,
  104132. "type": "SB_LUT4",
  104133. "parameters": {
  104134. "LUT_INIT": "0110100110010110"
  104135. },
  104136. "attributes": {
  104137. "module_not_derived": "00000000000000000000000000000001",
  104138. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104139. },
  104140. "port_directions": {
  104141. "I0": "input",
  104142. "I1": "input",
  104143. "I2": "input",
  104144. "I3": "input",
  104145. "O": "output"
  104146. },
  104147. "connections": {
  104148. "I0": [ "0" ],
  104149. "I1": [ 4666 ],
  104150. "I2": [ 4667 ],
  104151. "I3": [ 4668 ],
  104152. "O": [ 4669 ]
  104153. }
  104154. },
  104155. "cpu_I.execute_MUL_HL_SB_LUT4_O_2_I2_SB_LUT4_O": {
  104156. "hide_name": 0,
  104157. "type": "SB_LUT4",
  104158. "parameters": {
  104159. "LUT_INIT": "0000111100000000"
  104160. },
  104161. "attributes": {
  104162. "module_not_derived": "00000000000000000000000000000001",
  104163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104164. },
  104165. "port_directions": {
  104166. "I0": "input",
  104167. "I1": "input",
  104168. "I2": "input",
  104169. "I3": "input",
  104170. "O": "output"
  104171. },
  104172. "connections": {
  104173. "I0": [ "0" ],
  104174. "I1": [ "0" ],
  104175. "I2": [ 3641 ],
  104176. "I3": [ 4521 ],
  104177. "O": [ 4667 ]
  104178. }
  104179. },
  104180. "cpu_I.execute_MUL_HL_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  104181. "hide_name": 0,
  104182. "type": "SB_CARRY",
  104183. "parameters": {
  104184. },
  104185. "attributes": {
  104186. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104187. },
  104188. "port_directions": {
  104189. "CI": "input",
  104190. "CO": "output",
  104191. "I0": "input",
  104192. "I1": "input"
  104193. },
  104194. "connections": {
  104195. "CI": [ 4664 ],
  104196. "CO": [ 4668 ],
  104197. "I0": [ 4662 ],
  104198. "I1": [ 4663 ]
  104199. }
  104200. },
  104201. "cpu_I.execute_MUL_HL_SB_LUT4_O_3": {
  104202. "hide_name": 0,
  104203. "type": "SB_LUT4",
  104204. "parameters": {
  104205. "LUT_INIT": "0110100110010110"
  104206. },
  104207. "attributes": {
  104208. "module_not_derived": "00000000000000000000000000000001",
  104209. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104210. },
  104211. "port_directions": {
  104212. "I0": "input",
  104213. "I1": "input",
  104214. "I2": "input",
  104215. "I3": "input",
  104216. "O": "output"
  104217. },
  104218. "connections": {
  104219. "I0": [ "0" ],
  104220. "I1": [ 4670 ],
  104221. "I2": [ 4671 ],
  104222. "I3": [ 4672 ],
  104223. "O": [ 4673 ]
  104224. }
  104225. },
  104226. "cpu_I.execute_MUL_HL_SB_LUT4_O_3_I2_SB_LUT4_O": {
  104227. "hide_name": 0,
  104228. "type": "SB_LUT4",
  104229. "parameters": {
  104230. "LUT_INIT": "0000111100000000"
  104231. },
  104232. "attributes": {
  104233. "module_not_derived": "00000000000000000000000000000001",
  104234. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104235. },
  104236. "port_directions": {
  104237. "I0": "input",
  104238. "I1": "input",
  104239. "I2": "input",
  104240. "I3": "input",
  104241. "O": "output"
  104242. },
  104243. "connections": {
  104244. "I0": [ "0" ],
  104245. "I1": [ "0" ],
  104246. "I2": [ 3076 ],
  104247. "I3": [ 4521 ],
  104248. "O": [ 4671 ]
  104249. }
  104250. },
  104251. "cpu_I.execute_MUL_HL_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  104252. "hide_name": 0,
  104253. "type": "SB_CARRY",
  104254. "parameters": {
  104255. },
  104256. "attributes": {
  104257. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104258. },
  104259. "port_directions": {
  104260. "CI": "input",
  104261. "CO": "output",
  104262. "I0": "input",
  104263. "I1": "input"
  104264. },
  104265. "connections": {
  104266. "CI": [ 4668 ],
  104267. "CO": [ 4672 ],
  104268. "I0": [ 4666 ],
  104269. "I1": [ 4667 ]
  104270. }
  104271. },
  104272. "cpu_I.execute_MUL_HL_SB_LUT4_O_4": {
  104273. "hide_name": 0,
  104274. "type": "SB_LUT4",
  104275. "parameters": {
  104276. "LUT_INIT": "0110100110010110"
  104277. },
  104278. "attributes": {
  104279. "module_not_derived": "00000000000000000000000000000001",
  104280. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104281. },
  104282. "port_directions": {
  104283. "I0": "input",
  104284. "I1": "input",
  104285. "I2": "input",
  104286. "I3": "input",
  104287. "O": "output"
  104288. },
  104289. "connections": {
  104290. "I0": [ "0" ],
  104291. "I1": [ 4674 ],
  104292. "I2": [ 4675 ],
  104293. "I3": [ 4676 ],
  104294. "O": [ 4677 ]
  104295. }
  104296. },
  104297. "cpu_I.execute_MUL_HL_SB_LUT4_O_4_I2_SB_LUT4_O": {
  104298. "hide_name": 0,
  104299. "type": "SB_LUT4",
  104300. "parameters": {
  104301. "LUT_INIT": "0000111100000000"
  104302. },
  104303. "attributes": {
  104304. "module_not_derived": "00000000000000000000000000000001",
  104305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104306. },
  104307. "port_directions": {
  104308. "I0": "input",
  104309. "I1": "input",
  104310. "I2": "input",
  104311. "I3": "input",
  104312. "O": "output"
  104313. },
  104314. "connections": {
  104315. "I0": [ "0" ],
  104316. "I1": [ "0" ],
  104317. "I2": [ 2870 ],
  104318. "I3": [ 4521 ],
  104319. "O": [ 4675 ]
  104320. }
  104321. },
  104322. "cpu_I.execute_MUL_HL_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  104323. "hide_name": 0,
  104324. "type": "SB_CARRY",
  104325. "parameters": {
  104326. },
  104327. "attributes": {
  104328. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104329. },
  104330. "port_directions": {
  104331. "CI": "input",
  104332. "CO": "output",
  104333. "I0": "input",
  104334. "I1": "input"
  104335. },
  104336. "connections": {
  104337. "CI": [ 4672 ],
  104338. "CO": [ 4676 ],
  104339. "I0": [ 4670 ],
  104340. "I1": [ 4671 ]
  104341. }
  104342. },
  104343. "cpu_I.execute_MUL_HL_SB_LUT4_O_5": {
  104344. "hide_name": 0,
  104345. "type": "SB_LUT4",
  104346. "parameters": {
  104347. "LUT_INIT": "0110100110010110"
  104348. },
  104349. "attributes": {
  104350. "module_not_derived": "00000000000000000000000000000001",
  104351. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104352. },
  104353. "port_directions": {
  104354. "I0": "input",
  104355. "I1": "input",
  104356. "I2": "input",
  104357. "I3": "input",
  104358. "O": "output"
  104359. },
  104360. "connections": {
  104361. "I0": [ "0" ],
  104362. "I1": [ 4678 ],
  104363. "I2": [ 4679 ],
  104364. "I3": [ 4680 ],
  104365. "O": [ 4681 ]
  104366. }
  104367. },
  104368. "cpu_I.execute_MUL_HL_SB_LUT4_O_5_I2_SB_LUT4_O": {
  104369. "hide_name": 0,
  104370. "type": "SB_LUT4",
  104371. "parameters": {
  104372. "LUT_INIT": "0000111100000000"
  104373. },
  104374. "attributes": {
  104375. "module_not_derived": "00000000000000000000000000000001",
  104376. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104377. },
  104378. "port_directions": {
  104379. "I0": "input",
  104380. "I1": "input",
  104381. "I2": "input",
  104382. "I3": "input",
  104383. "O": "output"
  104384. },
  104385. "connections": {
  104386. "I0": [ "0" ],
  104387. "I1": [ "0" ],
  104388. "I2": [ 2882 ],
  104389. "I3": [ 4521 ],
  104390. "O": [ 4679 ]
  104391. }
  104392. },
  104393. "cpu_I.execute_MUL_HL_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  104394. "hide_name": 0,
  104395. "type": "SB_CARRY",
  104396. "parameters": {
  104397. },
  104398. "attributes": {
  104399. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104400. },
  104401. "port_directions": {
  104402. "CI": "input",
  104403. "CO": "output",
  104404. "I0": "input",
  104405. "I1": "input"
  104406. },
  104407. "connections": {
  104408. "CI": [ 4676 ],
  104409. "CO": [ 4680 ],
  104410. "I0": [ 4674 ],
  104411. "I1": [ 4675 ]
  104412. }
  104413. },
  104414. "cpu_I.execute_MUL_HL_SB_LUT4_O_6": {
  104415. "hide_name": 0,
  104416. "type": "SB_LUT4",
  104417. "parameters": {
  104418. "LUT_INIT": "0110100110010110"
  104419. },
  104420. "attributes": {
  104421. "module_not_derived": "00000000000000000000000000000001",
  104422. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104423. },
  104424. "port_directions": {
  104425. "I0": "input",
  104426. "I1": "input",
  104427. "I2": "input",
  104428. "I3": "input",
  104429. "O": "output"
  104430. },
  104431. "connections": {
  104432. "I0": [ "0" ],
  104433. "I1": [ 4682 ],
  104434. "I2": [ 4683 ],
  104435. "I3": [ 4684 ],
  104436. "O": [ 4685 ]
  104437. }
  104438. },
  104439. "cpu_I.execute_MUL_HL_SB_LUT4_O_6_I2_SB_LUT4_O": {
  104440. "hide_name": 0,
  104441. "type": "SB_LUT4",
  104442. "parameters": {
  104443. "LUT_INIT": "0000111100000000"
  104444. },
  104445. "attributes": {
  104446. "module_not_derived": "00000000000000000000000000000001",
  104447. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104448. },
  104449. "port_directions": {
  104450. "I0": "input",
  104451. "I1": "input",
  104452. "I2": "input",
  104453. "I3": "input",
  104454. "O": "output"
  104455. },
  104456. "connections": {
  104457. "I0": [ "0" ],
  104458. "I1": [ "0" ],
  104459. "I2": [ 3657 ],
  104460. "I3": [ 4521 ],
  104461. "O": [ 4683 ]
  104462. }
  104463. },
  104464. "cpu_I.execute_MUL_HL_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  104465. "hide_name": 0,
  104466. "type": "SB_CARRY",
  104467. "parameters": {
  104468. },
  104469. "attributes": {
  104470. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104471. },
  104472. "port_directions": {
  104473. "CI": "input",
  104474. "CO": "output",
  104475. "I0": "input",
  104476. "I1": "input"
  104477. },
  104478. "connections": {
  104479. "CI": [ 4680 ],
  104480. "CO": [ 4684 ],
  104481. "I0": [ 4678 ],
  104482. "I1": [ 4679 ]
  104483. }
  104484. },
  104485. "cpu_I.execute_MUL_HL_SB_LUT4_O_7": {
  104486. "hide_name": 0,
  104487. "type": "SB_LUT4",
  104488. "parameters": {
  104489. "LUT_INIT": "0110100110010110"
  104490. },
  104491. "attributes": {
  104492. "module_not_derived": "00000000000000000000000000000001",
  104493. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104494. },
  104495. "port_directions": {
  104496. "I0": "input",
  104497. "I1": "input",
  104498. "I2": "input",
  104499. "I3": "input",
  104500. "O": "output"
  104501. },
  104502. "connections": {
  104503. "I0": [ "0" ],
  104504. "I1": [ 4686 ],
  104505. "I2": [ 4687 ],
  104506. "I3": [ 4688 ],
  104507. "O": [ 4689 ]
  104508. }
  104509. },
  104510. "cpu_I.execute_MUL_HL_SB_LUT4_O_7_I2_SB_LUT4_O": {
  104511. "hide_name": 0,
  104512. "type": "SB_LUT4",
  104513. "parameters": {
  104514. "LUT_INIT": "0000111100000000"
  104515. },
  104516. "attributes": {
  104517. "module_not_derived": "00000000000000000000000000000001",
  104518. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104519. },
  104520. "port_directions": {
  104521. "I0": "input",
  104522. "I1": "input",
  104523. "I2": "input",
  104524. "I3": "input",
  104525. "O": "output"
  104526. },
  104527. "connections": {
  104528. "I0": [ "0" ],
  104529. "I1": [ "0" ],
  104530. "I2": [ 2898 ],
  104531. "I3": [ 4521 ],
  104532. "O": [ 4687 ]
  104533. }
  104534. },
  104535. "cpu_I.execute_MUL_HL_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  104536. "hide_name": 0,
  104537. "type": "SB_CARRY",
  104538. "parameters": {
  104539. },
  104540. "attributes": {
  104541. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104542. },
  104543. "port_directions": {
  104544. "CI": "input",
  104545. "CO": "output",
  104546. "I0": "input",
  104547. "I1": "input"
  104548. },
  104549. "connections": {
  104550. "CI": [ 4684 ],
  104551. "CO": [ 4688 ],
  104552. "I0": [ 4682 ],
  104553. "I1": [ 4683 ]
  104554. }
  104555. },
  104556. "cpu_I.execute_MUL_HL_SB_LUT4_O_8": {
  104557. "hide_name": 0,
  104558. "type": "SB_LUT4",
  104559. "parameters": {
  104560. "LUT_INIT": "0110100110010110"
  104561. },
  104562. "attributes": {
  104563. "module_not_derived": "00000000000000000000000000000001",
  104564. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104565. },
  104566. "port_directions": {
  104567. "I0": "input",
  104568. "I1": "input",
  104569. "I2": "input",
  104570. "I3": "input",
  104571. "O": "output"
  104572. },
  104573. "connections": {
  104574. "I0": [ "0" ],
  104575. "I1": [ 4690 ],
  104576. "I2": [ 4691 ],
  104577. "I3": [ 4692 ],
  104578. "O": [ 4693 ]
  104579. }
  104580. },
  104581. "cpu_I.execute_MUL_HL_SB_LUT4_O_8_I2_SB_LUT4_O": {
  104582. "hide_name": 0,
  104583. "type": "SB_LUT4",
  104584. "parameters": {
  104585. "LUT_INIT": "0000111100000000"
  104586. },
  104587. "attributes": {
  104588. "module_not_derived": "00000000000000000000000000000001",
  104589. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104590. },
  104591. "port_directions": {
  104592. "I0": "input",
  104593. "I1": "input",
  104594. "I2": "input",
  104595. "I3": "input",
  104596. "O": "output"
  104597. },
  104598. "connections": {
  104599. "I0": [ "0" ],
  104600. "I1": [ "0" ],
  104601. "I2": [ 3664 ],
  104602. "I3": [ 4521 ],
  104603. "O": [ 4691 ]
  104604. }
  104605. },
  104606. "cpu_I.execute_MUL_HL_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  104607. "hide_name": 0,
  104608. "type": "SB_CARRY",
  104609. "parameters": {
  104610. },
  104611. "attributes": {
  104612. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104613. },
  104614. "port_directions": {
  104615. "CI": "input",
  104616. "CO": "output",
  104617. "I0": "input",
  104618. "I1": "input"
  104619. },
  104620. "connections": {
  104621. "CI": [ 4688 ],
  104622. "CO": [ 4692 ],
  104623. "I0": [ 4686 ],
  104624. "I1": [ 4687 ]
  104625. }
  104626. },
  104627. "cpu_I.execute_MUL_HL_SB_LUT4_O_9": {
  104628. "hide_name": 0,
  104629. "type": "SB_LUT4",
  104630. "parameters": {
  104631. "LUT_INIT": "0110100110010110"
  104632. },
  104633. "attributes": {
  104634. "module_not_derived": "00000000000000000000000000000001",
  104635. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104636. },
  104637. "port_directions": {
  104638. "I0": "input",
  104639. "I1": "input",
  104640. "I2": "input",
  104641. "I3": "input",
  104642. "O": "output"
  104643. },
  104644. "connections": {
  104645. "I0": [ "0" ],
  104646. "I1": [ 4641 ],
  104647. "I2": [ 4521 ],
  104648. "I3": [ 4640 ],
  104649. "O": [ 4694 ]
  104650. }
  104651. },
  104652. "cpu_I.execute_MUL_HL_SB_LUT4_O_9_I3_SB_LUT4_O": {
  104653. "hide_name": 0,
  104654. "type": "SB_LUT4",
  104655. "parameters": {
  104656. "LUT_INIT": "0000111100000000"
  104657. },
  104658. "attributes": {
  104659. "module_not_derived": "00000000000000000000000000000001",
  104660. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104661. },
  104662. "port_directions": {
  104663. "I0": "input",
  104664. "I1": "input",
  104665. "I2": "input",
  104666. "I3": "input",
  104667. "O": "output"
  104668. },
  104669. "connections": {
  104670. "I0": [ "0" ],
  104671. "I1": [ "0" ],
  104672. "I2": [ 3639 ],
  104673. "I3": [ 4521 ],
  104674. "O": [ 4640 ]
  104675. }
  104676. },
  104677. "cpu_I.execute_MUL_HL_SB_LUT4_O_I2_SB_LUT4_O": {
  104678. "hide_name": 0,
  104679. "type": "SB_LUT4",
  104680. "parameters": {
  104681. "LUT_INIT": "0000110011000000"
  104682. },
  104683. "attributes": {
  104684. "module_not_derived": "00000000000000000000000000000001",
  104685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  104686. },
  104687. "port_directions": {
  104688. "I0": "input",
  104689. "I1": "input",
  104690. "I2": "input",
  104691. "I3": "input",
  104692. "O": "output"
  104693. },
  104694. "connections": {
  104695. "I0": [ "0" ],
  104696. "I1": [ 2843 ],
  104697. "I2": [ 964 ],
  104698. "I3": [ 966 ],
  104699. "O": [ 4521 ]
  104700. }
  104701. },
  104702. "cpu_I.execute_MUL_HL_SB_LUT4_O_I3_SB_CARRY_CO": {
  104703. "hide_name": 0,
  104704. "type": "SB_CARRY",
  104705. "parameters": {
  104706. },
  104707. "attributes": {
  104708. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104709. },
  104710. "port_directions": {
  104711. "CI": "input",
  104712. "CO": "output",
  104713. "I0": "input",
  104714. "I1": "input"
  104715. },
  104716. "connections": {
  104717. "CI": [ 4692 ],
  104718. "CO": [ 4630 ],
  104719. "I0": [ 4690 ],
  104720. "I1": [ 4691 ]
  104721. }
  104722. },
  104723. "cpu_I.execute_MUL_LH_SB_LUT4_O": {
  104724. "hide_name": 0,
  104725. "type": "SB_LUT4",
  104726. "parameters": {
  104727. "LUT_INIT": "0110100110010110"
  104728. },
  104729. "attributes": {
  104730. "module_not_derived": "00000000000000000000000000000001",
  104731. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104732. },
  104733. "port_directions": {
  104734. "I0": "input",
  104735. "I1": "input",
  104736. "I2": "input",
  104737. "I3": "input",
  104738. "O": "output"
  104739. },
  104740. "connections": {
  104741. "I0": [ "0" ],
  104742. "I1": [ 4303 ],
  104743. "I2": [ "0" ],
  104744. "I3": [ 4695 ],
  104745. "O": [ 4696 ]
  104746. }
  104747. },
  104748. "cpu_I.execute_MUL_LH_SB_LUT4_O_1": {
  104749. "hide_name": 0,
  104750. "type": "SB_LUT4",
  104751. "parameters": {
  104752. "LUT_INIT": "0110100110010110"
  104753. },
  104754. "attributes": {
  104755. "module_not_derived": "00000000000000000000000000000001",
  104756. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104757. },
  104758. "port_directions": {
  104759. "I0": "input",
  104760. "I1": "input",
  104761. "I2": "input",
  104762. "I3": "input",
  104763. "O": "output"
  104764. },
  104765. "connections": {
  104766. "I0": [ "0" ],
  104767. "I1": [ 4697 ],
  104768. "I2": [ 4698 ],
  104769. "I3": [ 4699 ],
  104770. "O": [ 4700 ]
  104771. }
  104772. },
  104773. "cpu_I.execute_MUL_LH_SB_LUT4_O_10": {
  104774. "hide_name": 0,
  104775. "type": "SB_LUT4",
  104776. "parameters": {
  104777. "LUT_INIT": "0110100110010110"
  104778. },
  104779. "attributes": {
  104780. "module_not_derived": "00000000000000000000000000000001",
  104781. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104782. },
  104783. "port_directions": {
  104784. "I0": "input",
  104785. "I1": "input",
  104786. "I2": "input",
  104787. "I3": "input",
  104788. "O": "output"
  104789. },
  104790. "connections": {
  104791. "I0": [ "0" ],
  104792. "I1": [ 4701 ],
  104793. "I2": [ 4702 ],
  104794. "I3": [ 4703 ],
  104795. "O": [ 4704 ]
  104796. }
  104797. },
  104798. "cpu_I.execute_MUL_LH_SB_LUT4_O_10_I2_SB_LUT4_O": {
  104799. "hide_name": 0,
  104800. "type": "SB_LUT4",
  104801. "parameters": {
  104802. "LUT_INIT": "0000111100000000"
  104803. },
  104804. "attributes": {
  104805. "module_not_derived": "00000000000000000000000000000001",
  104806. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104807. },
  104808. "port_directions": {
  104809. "I0": "input",
  104810. "I1": "input",
  104811. "I2": "input",
  104812. "I3": "input",
  104813. "O": "output"
  104814. },
  104815. "connections": {
  104816. "I0": [ "0" ],
  104817. "I1": [ "0" ],
  104818. "I2": [ 2759 ],
  104819. "I3": [ 4303 ],
  104820. "O": [ 4702 ]
  104821. }
  104822. },
  104823. "cpu_I.execute_MUL_LH_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  104824. "hide_name": 0,
  104825. "type": "SB_CARRY",
  104826. "parameters": {
  104827. },
  104828. "attributes": {
  104829. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104830. },
  104831. "port_directions": {
  104832. "CI": "input",
  104833. "CO": "output",
  104834. "I0": "input",
  104835. "I1": "input"
  104836. },
  104837. "connections": {
  104838. "CI": [ 4705 ],
  104839. "CO": [ 4703 ],
  104840. "I0": [ 4706 ],
  104841. "I1": [ 4707 ]
  104842. }
  104843. },
  104844. "cpu_I.execute_MUL_LH_SB_LUT4_O_11": {
  104845. "hide_name": 0,
  104846. "type": "SB_LUT4",
  104847. "parameters": {
  104848. "LUT_INIT": "0110100110010110"
  104849. },
  104850. "attributes": {
  104851. "module_not_derived": "00000000000000000000000000000001",
  104852. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104853. },
  104854. "port_directions": {
  104855. "I0": "input",
  104856. "I1": "input",
  104857. "I2": "input",
  104858. "I3": "input",
  104859. "O": "output"
  104860. },
  104861. "connections": {
  104862. "I0": [ "0" ],
  104863. "I1": [ 4708 ],
  104864. "I2": [ 4709 ],
  104865. "I3": [ 4710 ],
  104866. "O": [ 4711 ]
  104867. }
  104868. },
  104869. "cpu_I.execute_MUL_LH_SB_LUT4_O_11_I2_SB_LUT4_O": {
  104870. "hide_name": 0,
  104871. "type": "SB_LUT4",
  104872. "parameters": {
  104873. "LUT_INIT": "0000111100000000"
  104874. },
  104875. "attributes": {
  104876. "module_not_derived": "00000000000000000000000000000001",
  104877. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104878. },
  104879. "port_directions": {
  104880. "I0": "input",
  104881. "I1": "input",
  104882. "I2": "input",
  104883. "I3": "input",
  104884. "O": "output"
  104885. },
  104886. "connections": {
  104887. "I0": [ "0" ],
  104888. "I1": [ "0" ],
  104889. "I2": [ 2848 ],
  104890. "I3": [ 4303 ],
  104891. "O": [ 4709 ]
  104892. }
  104893. },
  104894. "cpu_I.execute_MUL_LH_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  104895. "hide_name": 0,
  104896. "type": "SB_CARRY",
  104897. "parameters": {
  104898. },
  104899. "attributes": {
  104900. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104901. },
  104902. "port_directions": {
  104903. "CI": "input",
  104904. "CO": "output",
  104905. "I0": "input",
  104906. "I1": "input"
  104907. },
  104908. "connections": {
  104909. "CI": [ 4703 ],
  104910. "CO": [ 4710 ],
  104911. "I0": [ 4701 ],
  104912. "I1": [ 4702 ]
  104913. }
  104914. },
  104915. "cpu_I.execute_MUL_LH_SB_LUT4_O_12": {
  104916. "hide_name": 0,
  104917. "type": "SB_LUT4",
  104918. "parameters": {
  104919. "LUT_INIT": "0110100110010110"
  104920. },
  104921. "attributes": {
  104922. "module_not_derived": "00000000000000000000000000000001",
  104923. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104924. },
  104925. "port_directions": {
  104926. "I0": "input",
  104927. "I1": "input",
  104928. "I2": "input",
  104929. "I3": "input",
  104930. "O": "output"
  104931. },
  104932. "connections": {
  104933. "I0": [ "0" ],
  104934. "I1": [ 4712 ],
  104935. "I2": [ 4713 ],
  104936. "I3": [ 4714 ],
  104937. "O": [ 4715 ]
  104938. }
  104939. },
  104940. "cpu_I.execute_MUL_LH_SB_LUT4_O_12_I2_SB_LUT4_O": {
  104941. "hide_name": 0,
  104942. "type": "SB_LUT4",
  104943. "parameters": {
  104944. "LUT_INIT": "0000111100000000"
  104945. },
  104946. "attributes": {
  104947. "module_not_derived": "00000000000000000000000000000001",
  104948. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  104949. },
  104950. "port_directions": {
  104951. "I0": "input",
  104952. "I1": "input",
  104953. "I2": "input",
  104954. "I3": "input",
  104955. "O": "output"
  104956. },
  104957. "connections": {
  104958. "I0": [ "0" ],
  104959. "I1": [ "0" ],
  104960. "I2": [ 4120 ],
  104961. "I3": [ 4303 ],
  104962. "O": [ 4713 ]
  104963. }
  104964. },
  104965. "cpu_I.execute_MUL_LH_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  104966. "hide_name": 0,
  104967. "type": "SB_CARRY",
  104968. "parameters": {
  104969. },
  104970. "attributes": {
  104971. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  104972. },
  104973. "port_directions": {
  104974. "CI": "input",
  104975. "CO": "output",
  104976. "I0": "input",
  104977. "I1": "input"
  104978. },
  104979. "connections": {
  104980. "CI": [ 4710 ],
  104981. "CO": [ 4714 ],
  104982. "I0": [ 4708 ],
  104983. "I1": [ 4709 ]
  104984. }
  104985. },
  104986. "cpu_I.execute_MUL_LH_SB_LUT4_O_13": {
  104987. "hide_name": 0,
  104988. "type": "SB_LUT4",
  104989. "parameters": {
  104990. "LUT_INIT": "0110100110010110"
  104991. },
  104992. "attributes": {
  104993. "module_not_derived": "00000000000000000000000000000001",
  104994. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  104995. },
  104996. "port_directions": {
  104997. "I0": "input",
  104998. "I1": "input",
  104999. "I2": "input",
  105000. "I3": "input",
  105001. "O": "output"
  105002. },
  105003. "connections": {
  105004. "I0": [ "0" ],
  105005. "I1": [ 4716 ],
  105006. "I2": [ 4717 ],
  105007. "I3": [ 4718 ],
  105008. "O": [ 4719 ]
  105009. }
  105010. },
  105011. "cpu_I.execute_MUL_LH_SB_LUT4_O_13_I2_SB_LUT4_O": {
  105012. "hide_name": 0,
  105013. "type": "SB_LUT4",
  105014. "parameters": {
  105015. "LUT_INIT": "0000111100000000"
  105016. },
  105017. "attributes": {
  105018. "module_not_derived": "00000000000000000000000000000001",
  105019. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105020. },
  105021. "port_directions": {
  105022. "I0": "input",
  105023. "I1": "input",
  105024. "I2": "input",
  105025. "I3": "input",
  105026. "O": "output"
  105027. },
  105028. "connections": {
  105029. "I0": [ "0" ],
  105030. "I1": [ "0" ],
  105031. "I2": [ 4115 ],
  105032. "I3": [ 4303 ],
  105033. "O": [ 4717 ]
  105034. }
  105035. },
  105036. "cpu_I.execute_MUL_LH_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  105037. "hide_name": 0,
  105038. "type": "SB_CARRY",
  105039. "parameters": {
  105040. },
  105041. "attributes": {
  105042. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105043. },
  105044. "port_directions": {
  105045. "CI": "input",
  105046. "CO": "output",
  105047. "I0": "input",
  105048. "I1": "input"
  105049. },
  105050. "connections": {
  105051. "CI": [ 4714 ],
  105052. "CO": [ 4718 ],
  105053. "I0": [ 4712 ],
  105054. "I1": [ 4713 ]
  105055. }
  105056. },
  105057. "cpu_I.execute_MUL_LH_SB_LUT4_O_14": {
  105058. "hide_name": 0,
  105059. "type": "SB_LUT4",
  105060. "parameters": {
  105061. "LUT_INIT": "0110100110010110"
  105062. },
  105063. "attributes": {
  105064. "module_not_derived": "00000000000000000000000000000001",
  105065. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105066. },
  105067. "port_directions": {
  105068. "I0": "input",
  105069. "I1": "input",
  105070. "I2": "input",
  105071. "I3": "input",
  105072. "O": "output"
  105073. },
  105074. "connections": {
  105075. "I0": [ "0" ],
  105076. "I1": [ 4720 ],
  105077. "I2": [ 4721 ],
  105078. "I3": [ 4722 ],
  105079. "O": [ 4723 ]
  105080. }
  105081. },
  105082. "cpu_I.execute_MUL_LH_SB_LUT4_O_14_I2_SB_LUT4_O": {
  105083. "hide_name": 0,
  105084. "type": "SB_LUT4",
  105085. "parameters": {
  105086. "LUT_INIT": "0000111100000000"
  105087. },
  105088. "attributes": {
  105089. "module_not_derived": "00000000000000000000000000000001",
  105090. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105091. },
  105092. "port_directions": {
  105093. "I0": "input",
  105094. "I1": "input",
  105095. "I2": "input",
  105096. "I3": "input",
  105097. "O": "output"
  105098. },
  105099. "connections": {
  105100. "I0": [ "0" ],
  105101. "I1": [ "0" ],
  105102. "I2": [ 4110 ],
  105103. "I3": [ 4303 ],
  105104. "O": [ 4721 ]
  105105. }
  105106. },
  105107. "cpu_I.execute_MUL_LH_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  105108. "hide_name": 0,
  105109. "type": "SB_CARRY",
  105110. "parameters": {
  105111. },
  105112. "attributes": {
  105113. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105114. },
  105115. "port_directions": {
  105116. "CI": "input",
  105117. "CO": "output",
  105118. "I0": "input",
  105119. "I1": "input"
  105120. },
  105121. "connections": {
  105122. "CI": [ 4718 ],
  105123. "CO": [ 4722 ],
  105124. "I0": [ 4716 ],
  105125. "I1": [ 4717 ]
  105126. }
  105127. },
  105128. "cpu_I.execute_MUL_LH_SB_LUT4_O_15": {
  105129. "hide_name": 0,
  105130. "type": "SB_LUT4",
  105131. "parameters": {
  105132. "LUT_INIT": "0110100110010110"
  105133. },
  105134. "attributes": {
  105135. "module_not_derived": "00000000000000000000000000000001",
  105136. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105137. },
  105138. "port_directions": {
  105139. "I0": "input",
  105140. "I1": "input",
  105141. "I2": "input",
  105142. "I3": "input",
  105143. "O": "output"
  105144. },
  105145. "connections": {
  105146. "I0": [ "0" ],
  105147. "I1": [ 4724 ],
  105148. "I2": [ 4725 ],
  105149. "I3": [ 4726 ],
  105150. "O": [ 4727 ]
  105151. }
  105152. },
  105153. "cpu_I.execute_MUL_LH_SB_LUT4_O_15_I2_SB_LUT4_O": {
  105154. "hide_name": 0,
  105155. "type": "SB_LUT4",
  105156. "parameters": {
  105157. "LUT_INIT": "0000111100000000"
  105158. },
  105159. "attributes": {
  105160. "module_not_derived": "00000000000000000000000000000001",
  105161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105162. },
  105163. "port_directions": {
  105164. "I0": "input",
  105165. "I1": "input",
  105166. "I2": "input",
  105167. "I3": "input",
  105168. "O": "output"
  105169. },
  105170. "connections": {
  105171. "I0": [ "0" ],
  105172. "I1": [ "0" ],
  105173. "I2": [ 2846 ],
  105174. "I3": [ 4303 ],
  105175. "O": [ 4725 ]
  105176. }
  105177. },
  105178. "cpu_I.execute_MUL_LH_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  105179. "hide_name": 0,
  105180. "type": "SB_CARRY",
  105181. "parameters": {
  105182. },
  105183. "attributes": {
  105184. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105185. },
  105186. "port_directions": {
  105187. "CI": "input",
  105188. "CO": "output",
  105189. "I0": "input",
  105190. "I1": "input"
  105191. },
  105192. "connections": {
  105193. "CI": [ 4722 ],
  105194. "CO": [ 4726 ],
  105195. "I0": [ 4720 ],
  105196. "I1": [ 4721 ]
  105197. }
  105198. },
  105199. "cpu_I.execute_MUL_LH_SB_LUT4_O_16": {
  105200. "hide_name": 0,
  105201. "type": "SB_LUT4",
  105202. "parameters": {
  105203. "LUT_INIT": "0110100110010110"
  105204. },
  105205. "attributes": {
  105206. "module_not_derived": "00000000000000000000000000000001",
  105207. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105208. },
  105209. "port_directions": {
  105210. "I0": "input",
  105211. "I1": "input",
  105212. "I2": "input",
  105213. "I3": "input",
  105214. "O": "output"
  105215. },
  105216. "connections": {
  105217. "I0": [ "0" ],
  105218. "I1": [ 4728 ],
  105219. "I2": [ 4729 ],
  105220. "I3": [ 4730 ],
  105221. "O": [ 4731 ]
  105222. }
  105223. },
  105224. "cpu_I.execute_MUL_LH_SB_LUT4_O_16_I2_SB_LUT4_O": {
  105225. "hide_name": 0,
  105226. "type": "SB_LUT4",
  105227. "parameters": {
  105228. "LUT_INIT": "0000111100000000"
  105229. },
  105230. "attributes": {
  105231. "module_not_derived": "00000000000000000000000000000001",
  105232. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105233. },
  105234. "port_directions": {
  105235. "I0": "input",
  105236. "I1": "input",
  105237. "I2": "input",
  105238. "I3": "input",
  105239. "O": "output"
  105240. },
  105241. "connections": {
  105242. "I0": [ "0" ],
  105243. "I1": [ "0" ],
  105244. "I2": [ 4099 ],
  105245. "I3": [ 4303 ],
  105246. "O": [ 4729 ]
  105247. }
  105248. },
  105249. "cpu_I.execute_MUL_LH_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  105250. "hide_name": 0,
  105251. "type": "SB_CARRY",
  105252. "parameters": {
  105253. },
  105254. "attributes": {
  105255. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105256. },
  105257. "port_directions": {
  105258. "CI": "input",
  105259. "CO": "output",
  105260. "I0": "input",
  105261. "I1": "input"
  105262. },
  105263. "connections": {
  105264. "CI": [ 4726 ],
  105265. "CO": [ 4730 ],
  105266. "I0": [ 4724 ],
  105267. "I1": [ 4725 ]
  105268. }
  105269. },
  105270. "cpu_I.execute_MUL_LH_SB_LUT4_O_1_I2_SB_LUT4_O": {
  105271. "hide_name": 0,
  105272. "type": "SB_LUT4",
  105273. "parameters": {
  105274. "LUT_INIT": "0000111100000000"
  105275. },
  105276. "attributes": {
  105277. "module_not_derived": "00000000000000000000000000000001",
  105278. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105279. },
  105280. "port_directions": {
  105281. "I0": "input",
  105282. "I1": "input",
  105283. "I2": "input",
  105284. "I3": "input",
  105285. "O": "output"
  105286. },
  105287. "connections": {
  105288. "I0": [ "0" ],
  105289. "I1": [ "0" ],
  105290. "I2": [ 4047 ],
  105291. "I3": [ 4303 ],
  105292. "O": [ 4698 ]
  105293. }
  105294. },
  105295. "cpu_I.execute_MUL_LH_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  105296. "hide_name": 0,
  105297. "type": "SB_CARRY",
  105298. "parameters": {
  105299. },
  105300. "attributes": {
  105301. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105302. },
  105303. "port_directions": {
  105304. "CI": "input",
  105305. "CO": "output",
  105306. "I0": "input",
  105307. "I1": "input"
  105308. },
  105309. "connections": {
  105310. "CI": [ 4730 ],
  105311. "CO": [ 4699 ],
  105312. "I0": [ 4728 ],
  105313. "I1": [ 4729 ]
  105314. }
  105315. },
  105316. "cpu_I.execute_MUL_LH_SB_LUT4_O_2": {
  105317. "hide_name": 0,
  105318. "type": "SB_LUT4",
  105319. "parameters": {
  105320. "LUT_INIT": "0110100110010110"
  105321. },
  105322. "attributes": {
  105323. "module_not_derived": "00000000000000000000000000000001",
  105324. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105325. },
  105326. "port_directions": {
  105327. "I0": "input",
  105328. "I1": "input",
  105329. "I2": "input",
  105330. "I3": "input",
  105331. "O": "output"
  105332. },
  105333. "connections": {
  105334. "I0": [ "0" ],
  105335. "I1": [ 4732 ],
  105336. "I2": [ 4733 ],
  105337. "I3": [ 4734 ],
  105338. "O": [ 4735 ]
  105339. }
  105340. },
  105341. "cpu_I.execute_MUL_LH_SB_LUT4_O_2_I2_SB_LUT4_O": {
  105342. "hide_name": 0,
  105343. "type": "SB_LUT4",
  105344. "parameters": {
  105345. "LUT_INIT": "0000111100000000"
  105346. },
  105347. "attributes": {
  105348. "module_not_derived": "00000000000000000000000000000001",
  105349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105350. },
  105351. "port_directions": {
  105352. "I0": "input",
  105353. "I1": "input",
  105354. "I2": "input",
  105355. "I3": "input",
  105356. "O": "output"
  105357. },
  105358. "connections": {
  105359. "I0": [ "0" ],
  105360. "I1": [ "0" ],
  105361. "I2": [ 4098 ],
  105362. "I3": [ 4303 ],
  105363. "O": [ 4733 ]
  105364. }
  105365. },
  105366. "cpu_I.execute_MUL_LH_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  105367. "hide_name": 0,
  105368. "type": "SB_CARRY",
  105369. "parameters": {
  105370. },
  105371. "attributes": {
  105372. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105373. },
  105374. "port_directions": {
  105375. "CI": "input",
  105376. "CO": "output",
  105377. "I0": "input",
  105378. "I1": "input"
  105379. },
  105380. "connections": {
  105381. "CI": [ 4699 ],
  105382. "CO": [ 4734 ],
  105383. "I0": [ 4697 ],
  105384. "I1": [ 4698 ]
  105385. }
  105386. },
  105387. "cpu_I.execute_MUL_LH_SB_LUT4_O_3": {
  105388. "hide_name": 0,
  105389. "type": "SB_LUT4",
  105390. "parameters": {
  105391. "LUT_INIT": "0110100110010110"
  105392. },
  105393. "attributes": {
  105394. "module_not_derived": "00000000000000000000000000000001",
  105395. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105396. },
  105397. "port_directions": {
  105398. "I0": "input",
  105399. "I1": "input",
  105400. "I2": "input",
  105401. "I3": "input",
  105402. "O": "output"
  105403. },
  105404. "connections": {
  105405. "I0": [ "0" ],
  105406. "I1": [ 4736 ],
  105407. "I2": [ 4737 ],
  105408. "I3": [ 4738 ],
  105409. "O": [ 4739 ]
  105410. }
  105411. },
  105412. "cpu_I.execute_MUL_LH_SB_LUT4_O_3_I2_SB_LUT4_O": {
  105413. "hide_name": 0,
  105414. "type": "SB_LUT4",
  105415. "parameters": {
  105416. "LUT_INIT": "0000111100000000"
  105417. },
  105418. "attributes": {
  105419. "module_not_derived": "00000000000000000000000000000001",
  105420. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105421. },
  105422. "port_directions": {
  105423. "I0": "input",
  105424. "I1": "input",
  105425. "I2": "input",
  105426. "I3": "input",
  105427. "O": "output"
  105428. },
  105429. "connections": {
  105430. "I0": [ "0" ],
  105431. "I1": [ "0" ],
  105432. "I2": [ 2852 ],
  105433. "I3": [ 4303 ],
  105434. "O": [ 4737 ]
  105435. }
  105436. },
  105437. "cpu_I.execute_MUL_LH_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  105438. "hide_name": 0,
  105439. "type": "SB_CARRY",
  105440. "parameters": {
  105441. },
  105442. "attributes": {
  105443. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105444. },
  105445. "port_directions": {
  105446. "CI": "input",
  105447. "CO": "output",
  105448. "I0": "input",
  105449. "I1": "input"
  105450. },
  105451. "connections": {
  105452. "CI": [ 4734 ],
  105453. "CO": [ 4738 ],
  105454. "I0": [ 4732 ],
  105455. "I1": [ 4733 ]
  105456. }
  105457. },
  105458. "cpu_I.execute_MUL_LH_SB_LUT4_O_4": {
  105459. "hide_name": 0,
  105460. "type": "SB_LUT4",
  105461. "parameters": {
  105462. "LUT_INIT": "0110100110010110"
  105463. },
  105464. "attributes": {
  105465. "module_not_derived": "00000000000000000000000000000001",
  105466. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105467. },
  105468. "port_directions": {
  105469. "I0": "input",
  105470. "I1": "input",
  105471. "I2": "input",
  105472. "I3": "input",
  105473. "O": "output"
  105474. },
  105475. "connections": {
  105476. "I0": [ "0" ],
  105477. "I1": [ 4740 ],
  105478. "I2": [ 4741 ],
  105479. "I3": [ 4742 ],
  105480. "O": [ 4743 ]
  105481. }
  105482. },
  105483. "cpu_I.execute_MUL_LH_SB_LUT4_O_4_I2_SB_LUT4_O": {
  105484. "hide_name": 0,
  105485. "type": "SB_LUT4",
  105486. "parameters": {
  105487. "LUT_INIT": "0000111100000000"
  105488. },
  105489. "attributes": {
  105490. "module_not_derived": "00000000000000000000000000000001",
  105491. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105492. },
  105493. "port_directions": {
  105494. "I0": "input",
  105495. "I1": "input",
  105496. "I2": "input",
  105497. "I3": "input",
  105498. "O": "output"
  105499. },
  105500. "connections": {
  105501. "I0": [ "0" ],
  105502. "I1": [ "0" ],
  105503. "I2": [ 4089 ],
  105504. "I3": [ 4303 ],
  105505. "O": [ 4741 ]
  105506. }
  105507. },
  105508. "cpu_I.execute_MUL_LH_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  105509. "hide_name": 0,
  105510. "type": "SB_CARRY",
  105511. "parameters": {
  105512. },
  105513. "attributes": {
  105514. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105515. },
  105516. "port_directions": {
  105517. "CI": "input",
  105518. "CO": "output",
  105519. "I0": "input",
  105520. "I1": "input"
  105521. },
  105522. "connections": {
  105523. "CI": [ 4738 ],
  105524. "CO": [ 4742 ],
  105525. "I0": [ 4736 ],
  105526. "I1": [ 4737 ]
  105527. }
  105528. },
  105529. "cpu_I.execute_MUL_LH_SB_LUT4_O_5": {
  105530. "hide_name": 0,
  105531. "type": "SB_LUT4",
  105532. "parameters": {
  105533. "LUT_INIT": "0110100110010110"
  105534. },
  105535. "attributes": {
  105536. "module_not_derived": "00000000000000000000000000000001",
  105537. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105538. },
  105539. "port_directions": {
  105540. "I0": "input",
  105541. "I1": "input",
  105542. "I2": "input",
  105543. "I3": "input",
  105544. "O": "output"
  105545. },
  105546. "connections": {
  105547. "I0": [ "0" ],
  105548. "I1": [ 4744 ],
  105549. "I2": [ 4745 ],
  105550. "I3": [ 4746 ],
  105551. "O": [ 4747 ]
  105552. }
  105553. },
  105554. "cpu_I.execute_MUL_LH_SB_LUT4_O_5_I2_SB_LUT4_O": {
  105555. "hide_name": 0,
  105556. "type": "SB_LUT4",
  105557. "parameters": {
  105558. "LUT_INIT": "0000111100000000"
  105559. },
  105560. "attributes": {
  105561. "module_not_derived": "00000000000000000000000000000001",
  105562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105563. },
  105564. "port_directions": {
  105565. "I0": "input",
  105566. "I1": "input",
  105567. "I2": "input",
  105568. "I3": "input",
  105569. "O": "output"
  105570. },
  105571. "connections": {
  105572. "I0": [ "0" ],
  105573. "I1": [ "0" ],
  105574. "I2": [ 4084 ],
  105575. "I3": [ 4303 ],
  105576. "O": [ 4745 ]
  105577. }
  105578. },
  105579. "cpu_I.execute_MUL_LH_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  105580. "hide_name": 0,
  105581. "type": "SB_CARRY",
  105582. "parameters": {
  105583. },
  105584. "attributes": {
  105585. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105586. },
  105587. "port_directions": {
  105588. "CI": "input",
  105589. "CO": "output",
  105590. "I0": "input",
  105591. "I1": "input"
  105592. },
  105593. "connections": {
  105594. "CI": [ 4742 ],
  105595. "CO": [ 4746 ],
  105596. "I0": [ 4740 ],
  105597. "I1": [ 4741 ]
  105598. }
  105599. },
  105600. "cpu_I.execute_MUL_LH_SB_LUT4_O_6": {
  105601. "hide_name": 0,
  105602. "type": "SB_LUT4",
  105603. "parameters": {
  105604. "LUT_INIT": "0110100110010110"
  105605. },
  105606. "attributes": {
  105607. "module_not_derived": "00000000000000000000000000000001",
  105608. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105609. },
  105610. "port_directions": {
  105611. "I0": "input",
  105612. "I1": "input",
  105613. "I2": "input",
  105614. "I3": "input",
  105615. "O": "output"
  105616. },
  105617. "connections": {
  105618. "I0": [ "0" ],
  105619. "I1": [ 4748 ],
  105620. "I2": [ 4749 ],
  105621. "I3": [ 4750 ],
  105622. "O": [ 4751 ]
  105623. }
  105624. },
  105625. "cpu_I.execute_MUL_LH_SB_LUT4_O_6_I2_SB_LUT4_O": {
  105626. "hide_name": 0,
  105627. "type": "SB_LUT4",
  105628. "parameters": {
  105629. "LUT_INIT": "0000111100000000"
  105630. },
  105631. "attributes": {
  105632. "module_not_derived": "00000000000000000000000000000001",
  105633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105634. },
  105635. "port_directions": {
  105636. "I0": "input",
  105637. "I1": "input",
  105638. "I2": "input",
  105639. "I3": "input",
  105640. "O": "output"
  105641. },
  105642. "connections": {
  105643. "I0": [ "0" ],
  105644. "I1": [ "0" ],
  105645. "I2": [ 4079 ],
  105646. "I3": [ 4303 ],
  105647. "O": [ 4749 ]
  105648. }
  105649. },
  105650. "cpu_I.execute_MUL_LH_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  105651. "hide_name": 0,
  105652. "type": "SB_CARRY",
  105653. "parameters": {
  105654. },
  105655. "attributes": {
  105656. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105657. },
  105658. "port_directions": {
  105659. "CI": "input",
  105660. "CO": "output",
  105661. "I0": "input",
  105662. "I1": "input"
  105663. },
  105664. "connections": {
  105665. "CI": [ 4746 ],
  105666. "CO": [ 4750 ],
  105667. "I0": [ 4744 ],
  105668. "I1": [ 4745 ]
  105669. }
  105670. },
  105671. "cpu_I.execute_MUL_LH_SB_LUT4_O_7": {
  105672. "hide_name": 0,
  105673. "type": "SB_LUT4",
  105674. "parameters": {
  105675. "LUT_INIT": "0110100110010110"
  105676. },
  105677. "attributes": {
  105678. "module_not_derived": "00000000000000000000000000000001",
  105679. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105680. },
  105681. "port_directions": {
  105682. "I0": "input",
  105683. "I1": "input",
  105684. "I2": "input",
  105685. "I3": "input",
  105686. "O": "output"
  105687. },
  105688. "connections": {
  105689. "I0": [ "0" ],
  105690. "I1": [ 4752 ],
  105691. "I2": [ 4753 ],
  105692. "I3": [ 4754 ],
  105693. "O": [ 4755 ]
  105694. }
  105695. },
  105696. "cpu_I.execute_MUL_LH_SB_LUT4_O_7_I2_SB_LUT4_O": {
  105697. "hide_name": 0,
  105698. "type": "SB_LUT4",
  105699. "parameters": {
  105700. "LUT_INIT": "0000111100000000"
  105701. },
  105702. "attributes": {
  105703. "module_not_derived": "00000000000000000000000000000001",
  105704. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105705. },
  105706. "port_directions": {
  105707. "I0": "input",
  105708. "I1": "input",
  105709. "I2": "input",
  105710. "I3": "input",
  105711. "O": "output"
  105712. },
  105713. "connections": {
  105714. "I0": [ "0" ],
  105715. "I1": [ "0" ],
  105716. "I2": [ 4074 ],
  105717. "I3": [ 4303 ],
  105718. "O": [ 4753 ]
  105719. }
  105720. },
  105721. "cpu_I.execute_MUL_LH_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  105722. "hide_name": 0,
  105723. "type": "SB_CARRY",
  105724. "parameters": {
  105725. },
  105726. "attributes": {
  105727. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105728. },
  105729. "port_directions": {
  105730. "CI": "input",
  105731. "CO": "output",
  105732. "I0": "input",
  105733. "I1": "input"
  105734. },
  105735. "connections": {
  105736. "CI": [ 4750 ],
  105737. "CO": [ 4754 ],
  105738. "I0": [ 4748 ],
  105739. "I1": [ 4749 ]
  105740. }
  105741. },
  105742. "cpu_I.execute_MUL_LH_SB_LUT4_O_8": {
  105743. "hide_name": 0,
  105744. "type": "SB_LUT4",
  105745. "parameters": {
  105746. "LUT_INIT": "0110100110010110"
  105747. },
  105748. "attributes": {
  105749. "module_not_derived": "00000000000000000000000000000001",
  105750. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105751. },
  105752. "port_directions": {
  105753. "I0": "input",
  105754. "I1": "input",
  105755. "I2": "input",
  105756. "I3": "input",
  105757. "O": "output"
  105758. },
  105759. "connections": {
  105760. "I0": [ "0" ],
  105761. "I1": [ 4756 ],
  105762. "I2": [ 4757 ],
  105763. "I3": [ 4303 ],
  105764. "O": [ 4758 ]
  105765. }
  105766. },
  105767. "cpu_I.execute_MUL_LH_SB_LUT4_O_8_I2_SB_LUT4_O": {
  105768. "hide_name": 0,
  105769. "type": "SB_LUT4",
  105770. "parameters": {
  105771. "LUT_INIT": "0000111100000000"
  105772. },
  105773. "attributes": {
  105774. "module_not_derived": "00000000000000000000000000000001",
  105775. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105776. },
  105777. "port_directions": {
  105778. "I0": "input",
  105779. "I1": "input",
  105780. "I2": "input",
  105781. "I3": "input",
  105782. "O": "output"
  105783. },
  105784. "connections": {
  105785. "I0": [ "0" ],
  105786. "I1": [ "0" ],
  105787. "I2": [ 2842 ],
  105788. "I3": [ 4303 ],
  105789. "O": [ 4757 ]
  105790. }
  105791. },
  105792. "cpu_I.execute_MUL_LH_SB_LUT4_O_9": {
  105793. "hide_name": 0,
  105794. "type": "SB_LUT4",
  105795. "parameters": {
  105796. "LUT_INIT": "0110100110010110"
  105797. },
  105798. "attributes": {
  105799. "module_not_derived": "00000000000000000000000000000001",
  105800. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105801. },
  105802. "port_directions": {
  105803. "I0": "input",
  105804. "I1": "input",
  105805. "I2": "input",
  105806. "I3": "input",
  105807. "O": "output"
  105808. },
  105809. "connections": {
  105810. "I0": [ "0" ],
  105811. "I1": [ 4706 ],
  105812. "I2": [ 4707 ],
  105813. "I3": [ 4705 ],
  105814. "O": [ 4759 ]
  105815. }
  105816. },
  105817. "cpu_I.execute_MUL_LH_SB_LUT4_O_9_I2_SB_LUT4_O": {
  105818. "hide_name": 0,
  105819. "type": "SB_LUT4",
  105820. "parameters": {
  105821. "LUT_INIT": "0000111100000000"
  105822. },
  105823. "attributes": {
  105824. "module_not_derived": "00000000000000000000000000000001",
  105825. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105826. },
  105827. "port_directions": {
  105828. "I0": "input",
  105829. "I1": "input",
  105830. "I2": "input",
  105831. "I3": "input",
  105832. "O": "output"
  105833. },
  105834. "connections": {
  105835. "I0": [ "0" ],
  105836. "I1": [ "0" ],
  105837. "I2": [ 2770 ],
  105838. "I3": [ 4303 ],
  105839. "O": [ 4707 ]
  105840. }
  105841. },
  105842. "cpu_I.execute_MUL_LH_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  105843. "hide_name": 0,
  105844. "type": "SB_CARRY",
  105845. "parameters": {
  105846. },
  105847. "attributes": {
  105848. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105849. },
  105850. "port_directions": {
  105851. "CI": "input",
  105852. "CO": "output",
  105853. "I0": "input",
  105854. "I1": "input"
  105855. },
  105856. "connections": {
  105857. "CI": [ 4303 ],
  105858. "CO": [ 4705 ],
  105859. "I0": [ 4756 ],
  105860. "I1": [ 4757 ]
  105861. }
  105862. },
  105863. "cpu_I.execute_MUL_LH_SB_LUT4_O_I3_SB_CARRY_CO": {
  105864. "hide_name": 0,
  105865. "type": "SB_CARRY",
  105866. "parameters": {
  105867. },
  105868. "attributes": {
  105869. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  105870. },
  105871. "port_directions": {
  105872. "CI": "input",
  105873. "CO": "output",
  105874. "I0": "input",
  105875. "I1": "input"
  105876. },
  105877. "connections": {
  105878. "CI": [ 4754 ],
  105879. "CO": [ 4695 ],
  105880. "I0": [ 4752 ],
  105881. "I1": [ 4753 ]
  105882. }
  105883. },
  105884. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O": {
  105885. "hide_name": 0,
  105886. "type": "SB_LUT4",
  105887. "parameters": {
  105888. "LUT_INIT": "1100100110011100"
  105889. },
  105890. "attributes": {
  105891. "module_not_derived": "00000000000000000000000000000001",
  105892. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105893. },
  105894. "port_directions": {
  105895. "I0": "input",
  105896. "I1": "input",
  105897. "I2": "input",
  105898. "I3": "input",
  105899. "O": "output"
  105900. },
  105901. "connections": {
  105902. "I0": [ 1254 ],
  105903. "I1": [ 2395 ],
  105904. "I2": [ 4760 ],
  105905. "I3": [ 4761 ],
  105906. "O": [ 3696 ]
  105907. }
  105908. },
  105909. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1": {
  105910. "hide_name": 0,
  105911. "type": "SB_LUT4",
  105912. "parameters": {
  105913. "LUT_INIT": "1100100110011100"
  105914. },
  105915. "attributes": {
  105916. "module_not_derived": "00000000000000000000000000000001",
  105917. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105918. },
  105919. "port_directions": {
  105920. "I0": "input",
  105921. "I1": "input",
  105922. "I2": "input",
  105923. "I3": "input",
  105924. "O": "output"
  105925. },
  105926. "connections": {
  105927. "I0": [ 1254 ],
  105928. "I1": [ 2397 ],
  105929. "I2": [ 4762 ],
  105930. "I3": [ 4763 ],
  105931. "O": [ 3071 ]
  105932. }
  105933. },
  105934. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10": {
  105935. "hide_name": 0,
  105936. "type": "SB_LUT4",
  105937. "parameters": {
  105938. "LUT_INIT": "1100100110011100"
  105939. },
  105940. "attributes": {
  105941. "module_not_derived": "00000000000000000000000000000001",
  105942. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105943. },
  105944. "port_directions": {
  105945. "I0": "input",
  105946. "I1": "input",
  105947. "I2": "input",
  105948. "I3": "input",
  105949. "O": "output"
  105950. },
  105951. "connections": {
  105952. "I0": [ 1254 ],
  105953. "I1": [ 2521 ],
  105954. "I2": [ 4764 ],
  105955. "I3": [ 4765 ],
  105956. "O": [ 3690 ]
  105957. }
  105958. },
  105959. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I1_SB_LUT4_O": {
  105960. "hide_name": 0,
  105961. "type": "SB_LUT4",
  105962. "parameters": {
  105963. "LUT_INIT": "0000101000001100"
  105964. },
  105965. "attributes": {
  105966. "module_not_derived": "00000000000000000000000000000001",
  105967. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  105968. },
  105969. "port_directions": {
  105970. "I0": "input",
  105971. "I1": "input",
  105972. "I2": "input",
  105973. "I3": "input",
  105974. "O": "output"
  105975. },
  105976. "connections": {
  105977. "I0": [ 952 ],
  105978. "I1": [ 4054 ],
  105979. "I2": [ 2757 ],
  105980. "I3": [ 2758 ],
  105981. "O": [ 2521 ]
  105982. }
  105983. },
  105984. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O": {
  105985. "hide_name": 0,
  105986. "type": "SB_LUT4",
  105987. "parameters": {
  105988. "LUT_INIT": "1111000000001111"
  105989. },
  105990. "attributes": {
  105991. "module_not_derived": "00000000000000000000000000000001",
  105992. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  105993. },
  105994. "port_directions": {
  105995. "I0": "input",
  105996. "I1": "input",
  105997. "I2": "input",
  105998. "I3": "input",
  105999. "O": "output"
  106000. },
  106001. "connections": {
  106002. "I0": [ "0" ],
  106003. "I1": [ "0" ],
  106004. "I2": [ 2991 ],
  106005. "I3": [ 4766 ],
  106006. "O": [ 4764 ]
  106007. }
  106008. },
  106009. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  106010. "hide_name": 0,
  106011. "type": "SB_LUT4",
  106012. "parameters": {
  106013. "LUT_INIT": "1111000000001111"
  106014. },
  106015. "attributes": {
  106016. "module_not_derived": "00000000000000000000000000000001",
  106017. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106018. },
  106019. "port_directions": {
  106020. "I0": "input",
  106021. "I1": "input",
  106022. "I2": "input",
  106023. "I3": "input",
  106024. "O": "output"
  106025. },
  106026. "connections": {
  106027. "I0": [ "0" ],
  106028. "I1": [ "0" ],
  106029. "I2": [ 2521 ],
  106030. "I3": [ 4766 ],
  106031. "O": [ 4298 ]
  106032. }
  106033. },
  106034. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  106035. "hide_name": 0,
  106036. "type": "SB_LUT4",
  106037. "parameters": {
  106038. "LUT_INIT": "0010111110010010"
  106039. },
  106040. "attributes": {
  106041. "module_not_derived": "00000000000000000000000000000001",
  106042. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106043. },
  106044. "port_directions": {
  106045. "I0": "input",
  106046. "I1": "input",
  106047. "I2": "input",
  106048. "I3": "input",
  106049. "O": "output"
  106050. },
  106051. "connections": {
  106052. "I0": [ 966 ],
  106053. "I1": [ 1250 ],
  106054. "I2": [ 2521 ],
  106055. "I3": [ 4766 ],
  106056. "O": [ 4767 ]
  106057. }
  106058. },
  106059. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  106060. "hide_name": 0,
  106061. "type": "SB_LUT4",
  106062. "parameters": {
  106063. "LUT_INIT": "0110010011111101"
  106064. },
  106065. "attributes": {
  106066. "module_not_derived": "00000000000000000000000000000001",
  106067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106068. },
  106069. "port_directions": {
  106070. "I0": "input",
  106071. "I1": "input",
  106072. "I2": "input",
  106073. "I3": "input",
  106074. "O": "output"
  106075. },
  106076. "connections": {
  106077. "I0": [ 1246 ],
  106078. "I1": [ 1247 ],
  106079. "I2": [ 4767 ],
  106080. "I3": [ 3690 ],
  106081. "O": [ 2921 ]
  106082. }
  106083. },
  106084. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  106085. "hide_name": 0,
  106086. "type": "SB_LUT4",
  106087. "parameters": {
  106088. "LUT_INIT": "0011111100000000"
  106089. },
  106090. "attributes": {
  106091. "module_not_derived": "00000000000000000000000000000001",
  106092. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  106093. },
  106094. "port_directions": {
  106095. "I0": "input",
  106096. "I1": "input",
  106097. "I2": "input",
  106098. "I3": "input",
  106099. "O": "output"
  106100. },
  106101. "connections": {
  106102. "I0": [ "0" ],
  106103. "I1": [ 1158 ],
  106104. "I2": [ 1034 ],
  106105. "I3": [ 4768 ],
  106106. "O": [ 2920 ]
  106107. }
  106108. },
  106109. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  106110. "hide_name": 0,
  106111. "type": "SB_LUT4",
  106112. "parameters": {
  106113. "LUT_INIT": "0001001101011111"
  106114. },
  106115. "attributes": {
  106116. "module_not_derived": "00000000000000000000000000000001",
  106117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106118. },
  106119. "port_directions": {
  106120. "I0": "input",
  106121. "I1": "input",
  106122. "I2": "input",
  106123. "I3": "input",
  106124. "O": "output"
  106125. },
  106126. "connections": {
  106127. "I0": [ 1072 ],
  106128. "I1": [ 1037 ],
  106129. "I2": [ 1043 ],
  106130. "I3": [ 4769 ],
  106131. "O": [ 4768 ]
  106132. }
  106133. },
  106134. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  106135. "hide_name": 0,
  106136. "type": "SB_DFFER",
  106137. "parameters": {
  106138. },
  106139. "attributes": {
  106140. "module_not_derived": "00000000000000000000000000000001",
  106141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  106142. },
  106143. "port_directions": {
  106144. "C": "input",
  106145. "D": "input",
  106146. "E": "input",
  106147. "Q": "output",
  106148. "R": "input"
  106149. },
  106150. "connections": {
  106151. "C": [ 42 ],
  106152. "D": [ 1191 ],
  106153. "E": [ 1040 ],
  106154. "Q": [ 4769 ],
  106155. "R": [ 127 ]
  106156. }
  106157. },
  106158. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  106159. "hide_name": 0,
  106160. "type": "SB_LUT4",
  106161. "parameters": {
  106162. "LUT_INIT": "0011111100000000"
  106163. },
  106164. "attributes": {
  106165. "module_not_derived": "00000000000000000000000000000001",
  106166. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  106167. },
  106168. "port_directions": {
  106169. "I0": "input",
  106170. "I1": "input",
  106171. "I2": "input",
  106172. "I3": "input",
  106173. "O": "output"
  106174. },
  106175. "connections": {
  106176. "I0": [ "0" ],
  106177. "I1": [ 4252 ],
  106178. "I2": [ 2868 ],
  106179. "I3": [ 4770 ],
  106180. "O": [ 4766 ]
  106181. }
  106182. },
  106183. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  106184. "hide_name": 0,
  106185. "type": "SB_LUT4",
  106186. "parameters": {
  106187. "LUT_INIT": "1111010101010011"
  106188. },
  106189. "attributes": {
  106190. "module_not_derived": "00000000000000000000000000000001",
  106191. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106192. },
  106193. "port_directions": {
  106194. "I0": "input",
  106195. "I1": "input",
  106196. "I2": "input",
  106197. "I3": "input",
  106198. "O": "output"
  106199. },
  106200. "connections": {
  106201. "I0": [ 943 ],
  106202. "I1": [ 3672 ],
  106203. "I2": [ 2871 ],
  106204. "I3": [ 2872 ],
  106205. "O": [ 4770 ]
  106206. }
  106207. },
  106208. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  106209. "hide_name": 0,
  106210. "type": "SB_CARRY",
  106211. "parameters": {
  106212. },
  106213. "attributes": {
  106214. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  106215. },
  106216. "port_directions": {
  106217. "CI": "input",
  106218. "CO": "output",
  106219. "I0": "input",
  106220. "I1": "input"
  106221. },
  106222. "connections": {
  106223. "CI": [ 4771 ],
  106224. "CO": [ 4765 ],
  106225. "I0": [ 2523 ],
  106226. "I1": [ 4772 ]
  106227. }
  106228. },
  106229. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_11": {
  106230. "hide_name": 0,
  106231. "type": "SB_LUT4",
  106232. "parameters": {
  106233. "LUT_INIT": "1100100110011100"
  106234. },
  106235. "attributes": {
  106236. "module_not_derived": "00000000000000000000000000000001",
  106237. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106238. },
  106239. "port_directions": {
  106240. "I0": "input",
  106241. "I1": "input",
  106242. "I2": "input",
  106243. "I3": "input",
  106244. "O": "output"
  106245. },
  106246. "connections": {
  106247. "I0": [ 1254 ],
  106248. "I1": [ 2398 ],
  106249. "I2": [ 4773 ],
  106250. "I3": [ 4774 ],
  106251. "O": [ 2929 ]
  106252. }
  106253. },
  106254. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_11_I2_SB_LUT4_O": {
  106255. "hide_name": 0,
  106256. "type": "SB_LUT4",
  106257. "parameters": {
  106258. "LUT_INIT": "1111000000001111"
  106259. },
  106260. "attributes": {
  106261. "module_not_derived": "00000000000000000000000000000001",
  106262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106263. },
  106264. "port_directions": {
  106265. "I0": "input",
  106266. "I1": "input",
  106267. "I2": "input",
  106268. "I3": "input",
  106269. "O": "output"
  106270. },
  106271. "connections": {
  106272. "I0": [ "0" ],
  106273. "I1": [ "0" ],
  106274. "I2": [ 2991 ],
  106275. "I3": [ 2930 ],
  106276. "O": [ 4773 ]
  106277. }
  106278. },
  106279. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  106280. "hide_name": 0,
  106281. "type": "SB_CARRY",
  106282. "parameters": {
  106283. },
  106284. "attributes": {
  106285. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  106286. },
  106287. "port_directions": {
  106288. "CI": "input",
  106289. "CO": "output",
  106290. "I0": "input",
  106291. "I1": "input"
  106292. },
  106293. "connections": {
  106294. "CI": [ 4765 ],
  106295. "CO": [ 4774 ],
  106296. "I0": [ 2521 ],
  106297. "I1": [ 4764 ]
  106298. }
  106299. },
  106300. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12": {
  106301. "hide_name": 0,
  106302. "type": "SB_LUT4",
  106303. "parameters": {
  106304. "LUT_INIT": "1100100110011100"
  106305. },
  106306. "attributes": {
  106307. "module_not_derived": "00000000000000000000000000000001",
  106308. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106309. },
  106310. "port_directions": {
  106311. "I0": "input",
  106312. "I1": "input",
  106313. "I2": "input",
  106314. "I3": "input",
  106315. "O": "output"
  106316. },
  106317. "connections": {
  106318. "I0": [ 1254 ],
  106319. "I1": [ 2396 ],
  106320. "I2": [ 4775 ],
  106321. "I3": [ 4776 ],
  106322. "O": [ 3703 ]
  106323. }
  106324. },
  106325. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O": {
  106326. "hide_name": 0,
  106327. "type": "SB_LUT4",
  106328. "parameters": {
  106329. "LUT_INIT": "1111000000001111"
  106330. },
  106331. "attributes": {
  106332. "module_not_derived": "00000000000000000000000000000001",
  106333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106334. },
  106335. "port_directions": {
  106336. "I0": "input",
  106337. "I1": "input",
  106338. "I2": "input",
  106339. "I3": "input",
  106340. "O": "output"
  106341. },
  106342. "connections": {
  106343. "I0": [ "0" ],
  106344. "I1": [ "0" ],
  106345. "I2": [ 2991 ],
  106346. "I3": [ 4777 ],
  106347. "O": [ 4775 ]
  106348. }
  106349. },
  106350. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  106351. "hide_name": 0,
  106352. "type": "SB_LUT4",
  106353. "parameters": {
  106354. "LUT_INIT": "1111000000001111"
  106355. },
  106356. "attributes": {
  106357. "module_not_derived": "00000000000000000000000000000001",
  106358. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106359. },
  106360. "port_directions": {
  106361. "I0": "input",
  106362. "I1": "input",
  106363. "I2": "input",
  106364. "I3": "input",
  106365. "O": "output"
  106366. },
  106367. "connections": {
  106368. "I0": [ "0" ],
  106369. "I1": [ "0" ],
  106370. "I2": [ 2396 ],
  106371. "I3": [ 4777 ],
  106372. "O": [ 4778 ]
  106373. }
  106374. },
  106375. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  106376. "hide_name": 0,
  106377. "type": "SB_LUT4",
  106378. "parameters": {
  106379. "LUT_INIT": "0010111110010010"
  106380. },
  106381. "attributes": {
  106382. "module_not_derived": "00000000000000000000000000000001",
  106383. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106384. },
  106385. "port_directions": {
  106386. "I0": "input",
  106387. "I1": "input",
  106388. "I2": "input",
  106389. "I3": "input",
  106390. "O": "output"
  106391. },
  106392. "connections": {
  106393. "I0": [ 966 ],
  106394. "I1": [ 1250 ],
  106395. "I2": [ 2396 ],
  106396. "I3": [ 4777 ],
  106397. "O": [ 4779 ]
  106398. }
  106399. },
  106400. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  106401. "hide_name": 0,
  106402. "type": "SB_LUT4",
  106403. "parameters": {
  106404. "LUT_INIT": "0110010011111101"
  106405. },
  106406. "attributes": {
  106407. "module_not_derived": "00000000000000000000000000000001",
  106408. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106409. },
  106410. "port_directions": {
  106411. "I0": "input",
  106412. "I1": "input",
  106413. "I2": "input",
  106414. "I3": "input",
  106415. "O": "output"
  106416. },
  106417. "connections": {
  106418. "I0": [ 1246 ],
  106419. "I1": [ 1247 ],
  106420. "I2": [ 4779 ],
  106421. "I3": [ 3703 ],
  106422. "O": [ 2938 ]
  106423. }
  106424. },
  106425. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  106426. "hide_name": 0,
  106427. "type": "SB_LUT4",
  106428. "parameters": {
  106429. "LUT_INIT": "0011111100000000"
  106430. },
  106431. "attributes": {
  106432. "module_not_derived": "00000000000000000000000000000001",
  106433. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  106434. },
  106435. "port_directions": {
  106436. "I0": "input",
  106437. "I1": "input",
  106438. "I2": "input",
  106439. "I3": "input",
  106440. "O": "output"
  106441. },
  106442. "connections": {
  106443. "I0": [ "0" ],
  106444. "I1": [ 1156 ],
  106445. "I2": [ 1034 ],
  106446. "I3": [ 4780 ],
  106447. "O": [ 2937 ]
  106448. }
  106449. },
  106450. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  106451. "hide_name": 0,
  106452. "type": "SB_LUT4",
  106453. "parameters": {
  106454. "LUT_INIT": "0001001101011111"
  106455. },
  106456. "attributes": {
  106457. "module_not_derived": "00000000000000000000000000000001",
  106458. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106459. },
  106460. "port_directions": {
  106461. "I0": "input",
  106462. "I1": "input",
  106463. "I2": "input",
  106464. "I3": "input",
  106465. "O": "output"
  106466. },
  106467. "connections": {
  106468. "I0": [ 1068 ],
  106469. "I1": [ 1037 ],
  106470. "I2": [ 1043 ],
  106471. "I3": [ 4781 ],
  106472. "O": [ 4780 ]
  106473. }
  106474. },
  106475. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  106476. "hide_name": 0,
  106477. "type": "SB_DFFER",
  106478. "parameters": {
  106479. },
  106480. "attributes": {
  106481. "module_not_derived": "00000000000000000000000000000001",
  106482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  106483. },
  106484. "port_directions": {
  106485. "C": "input",
  106486. "D": "input",
  106487. "E": "input",
  106488. "Q": "output",
  106489. "R": "input"
  106490. },
  106491. "connections": {
  106492. "C": [ 42 ],
  106493. "D": [ 1187 ],
  106494. "E": [ 1040 ],
  106495. "Q": [ 4781 ],
  106496. "R": [ 127 ]
  106497. }
  106498. },
  106499. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  106500. "hide_name": 0,
  106501. "type": "SB_LUT4",
  106502. "parameters": {
  106503. "LUT_INIT": "0011111100000000"
  106504. },
  106505. "attributes": {
  106506. "module_not_derived": "00000000000000000000000000000001",
  106507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  106508. },
  106509. "port_directions": {
  106510. "I0": "input",
  106511. "I1": "input",
  106512. "I2": "input",
  106513. "I3": "input",
  106514. "O": "output"
  106515. },
  106516. "connections": {
  106517. "I0": [ "0" ],
  106518. "I1": [ 4251 ],
  106519. "I2": [ 2868 ],
  106520. "I3": [ 4782 ],
  106521. "O": [ 4777 ]
  106522. }
  106523. },
  106524. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  106525. "hide_name": 0,
  106526. "type": "SB_LUT4",
  106527. "parameters": {
  106528. "LUT_INIT": "1111010101010011"
  106529. },
  106530. "attributes": {
  106531. "module_not_derived": "00000000000000000000000000000001",
  106532. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106533. },
  106534. "port_directions": {
  106535. "I0": "input",
  106536. "I1": "input",
  106537. "I2": "input",
  106538. "I3": "input",
  106539. "O": "output"
  106540. },
  106541. "connections": {
  106542. "I0": [ 943 ],
  106543. "I1": [ 3668 ],
  106544. "I2": [ 2871 ],
  106545. "I3": [ 2872 ],
  106546. "O": [ 4782 ]
  106547. }
  106548. },
  106549. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  106550. "hide_name": 0,
  106551. "type": "SB_CARRY",
  106552. "parameters": {
  106553. },
  106554. "attributes": {
  106555. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  106556. },
  106557. "port_directions": {
  106558. "CI": "input",
  106559. "CO": "output",
  106560. "I0": "input",
  106561. "I1": "input"
  106562. },
  106563. "connections": {
  106564. "CI": [ 4774 ],
  106565. "CO": [ 4776 ],
  106566. "I0": [ 2398 ],
  106567. "I1": [ 4773 ]
  106568. }
  106569. },
  106570. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13": {
  106571. "hide_name": 0,
  106572. "type": "SB_LUT4",
  106573. "parameters": {
  106574. "LUT_INIT": "1100100110011100"
  106575. },
  106576. "attributes": {
  106577. "module_not_derived": "00000000000000000000000000000001",
  106578. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106579. },
  106580. "port_directions": {
  106581. "I0": "input",
  106582. "I1": "input",
  106583. "I2": "input",
  106584. "I3": "input",
  106585. "O": "output"
  106586. },
  106587. "connections": {
  106588. "I0": [ 1254 ],
  106589. "I1": [ 2394 ],
  106590. "I2": [ 4783 ],
  106591. "I3": [ 4784 ],
  106592. "O": [ 3702 ]
  106593. }
  106594. },
  106595. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O": {
  106596. "hide_name": 0,
  106597. "type": "SB_LUT4",
  106598. "parameters": {
  106599. "LUT_INIT": "1111000000001111"
  106600. },
  106601. "attributes": {
  106602. "module_not_derived": "00000000000000000000000000000001",
  106603. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106604. },
  106605. "port_directions": {
  106606. "I0": "input",
  106607. "I1": "input",
  106608. "I2": "input",
  106609. "I3": "input",
  106610. "O": "output"
  106611. },
  106612. "connections": {
  106613. "I0": [ "0" ],
  106614. "I1": [ "0" ],
  106615. "I2": [ 2991 ],
  106616. "I3": [ 4785 ],
  106617. "O": [ 4783 ]
  106618. }
  106619. },
  106620. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  106621. "hide_name": 0,
  106622. "type": "SB_LUT4",
  106623. "parameters": {
  106624. "LUT_INIT": "1111000000001111"
  106625. },
  106626. "attributes": {
  106627. "module_not_derived": "00000000000000000000000000000001",
  106628. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106629. },
  106630. "port_directions": {
  106631. "I0": "input",
  106632. "I1": "input",
  106633. "I2": "input",
  106634. "I3": "input",
  106635. "O": "output"
  106636. },
  106637. "connections": {
  106638. "I0": [ "0" ],
  106639. "I1": [ "0" ],
  106640. "I2": [ 2394 ],
  106641. "I3": [ 4785 ],
  106642. "O": [ 3012 ]
  106643. }
  106644. },
  106645. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  106646. "hide_name": 0,
  106647. "type": "SB_LUT4",
  106648. "parameters": {
  106649. "LUT_INIT": "0010111110010010"
  106650. },
  106651. "attributes": {
  106652. "module_not_derived": "00000000000000000000000000000001",
  106653. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106654. },
  106655. "port_directions": {
  106656. "I0": "input",
  106657. "I1": "input",
  106658. "I2": "input",
  106659. "I3": "input",
  106660. "O": "output"
  106661. },
  106662. "connections": {
  106663. "I0": [ 966 ],
  106664. "I1": [ 1250 ],
  106665. "I2": [ 2394 ],
  106666. "I3": [ 4785 ],
  106667. "O": [ 4786 ]
  106668. }
  106669. },
  106670. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  106671. "hide_name": 0,
  106672. "type": "SB_LUT4",
  106673. "parameters": {
  106674. "LUT_INIT": "0110010011111101"
  106675. },
  106676. "attributes": {
  106677. "module_not_derived": "00000000000000000000000000000001",
  106678. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106679. },
  106680. "port_directions": {
  106681. "I0": "input",
  106682. "I1": "input",
  106683. "I2": "input",
  106684. "I3": "input",
  106685. "O": "output"
  106686. },
  106687. "connections": {
  106688. "I0": [ 1246 ],
  106689. "I1": [ 1247 ],
  106690. "I2": [ 4786 ],
  106691. "I3": [ 3702 ],
  106692. "O": [ 2941 ]
  106693. }
  106694. },
  106695. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  106696. "hide_name": 0,
  106697. "type": "SB_LUT4",
  106698. "parameters": {
  106699. "LUT_INIT": "0011111100000000"
  106700. },
  106701. "attributes": {
  106702. "module_not_derived": "00000000000000000000000000000001",
  106703. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  106704. },
  106705. "port_directions": {
  106706. "I0": "input",
  106707. "I1": "input",
  106708. "I2": "input",
  106709. "I3": "input",
  106710. "O": "output"
  106711. },
  106712. "connections": {
  106713. "I0": [ "0" ],
  106714. "I1": [ 1182 ],
  106715. "I2": [ 1034 ],
  106716. "I3": [ 4787 ],
  106717. "O": [ 2940 ]
  106718. }
  106719. },
  106720. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  106721. "hide_name": 0,
  106722. "type": "SB_LUT4",
  106723. "parameters": {
  106724. "LUT_INIT": "0001001101011111"
  106725. },
  106726. "attributes": {
  106727. "module_not_derived": "00000000000000000000000000000001",
  106728. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106729. },
  106730. "port_directions": {
  106731. "I0": "input",
  106732. "I1": "input",
  106733. "I2": "input",
  106734. "I3": "input",
  106735. "O": "output"
  106736. },
  106737. "connections": {
  106738. "I0": [ 1125 ],
  106739. "I1": [ 1037 ],
  106740. "I2": [ 1043 ],
  106741. "I3": [ 4788 ],
  106742. "O": [ 4787 ]
  106743. }
  106744. },
  106745. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  106746. "hide_name": 0,
  106747. "type": "SB_DFFER",
  106748. "parameters": {
  106749. },
  106750. "attributes": {
  106751. "module_not_derived": "00000000000000000000000000000001",
  106752. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  106753. },
  106754. "port_directions": {
  106755. "C": "input",
  106756. "D": "input",
  106757. "E": "input",
  106758. "Q": "output",
  106759. "R": "input"
  106760. },
  106761. "connections": {
  106762. "C": [ 42 ],
  106763. "D": [ 1237 ],
  106764. "E": [ 1040 ],
  106765. "Q": [ 4788 ],
  106766. "R": [ 127 ]
  106767. }
  106768. },
  106769. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  106770. "hide_name": 0,
  106771. "type": "SB_LUT4",
  106772. "parameters": {
  106773. "LUT_INIT": "0011111100000000"
  106774. },
  106775. "attributes": {
  106776. "module_not_derived": "00000000000000000000000000000001",
  106777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  106778. },
  106779. "port_directions": {
  106780. "I0": "input",
  106781. "I1": "input",
  106782. "I2": "input",
  106783. "I3": "input",
  106784. "O": "output"
  106785. },
  106786. "connections": {
  106787. "I0": [ "0" ],
  106788. "I1": [ 4266 ],
  106789. "I2": [ 2868 ],
  106790. "I3": [ 4789 ],
  106791. "O": [ 4785 ]
  106792. }
  106793. },
  106794. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  106795. "hide_name": 0,
  106796. "type": "SB_LUT4",
  106797. "parameters": {
  106798. "LUT_INIT": "1111010101010011"
  106799. },
  106800. "attributes": {
  106801. "module_not_derived": "00000000000000000000000000000001",
  106802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106803. },
  106804. "port_directions": {
  106805. "I0": "input",
  106806. "I1": "input",
  106807. "I2": "input",
  106808. "I3": "input",
  106809. "O": "output"
  106810. },
  106811. "connections": {
  106812. "I0": [ 943 ],
  106813. "I1": [ 3666 ],
  106814. "I2": [ 2871 ],
  106815. "I3": [ 2872 ],
  106816. "O": [ 4789 ]
  106817. }
  106818. },
  106819. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  106820. "hide_name": 0,
  106821. "type": "SB_CARRY",
  106822. "parameters": {
  106823. },
  106824. "attributes": {
  106825. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  106826. },
  106827. "port_directions": {
  106828. "CI": "input",
  106829. "CO": "output",
  106830. "I0": "input",
  106831. "I1": "input"
  106832. },
  106833. "connections": {
  106834. "CI": [ 4776 ],
  106835. "CO": [ 4784 ],
  106836. "I0": [ 2396 ],
  106837. "I1": [ 4775 ]
  106838. }
  106839. },
  106840. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_14": {
  106841. "hide_name": 0,
  106842. "type": "SB_LUT4",
  106843. "parameters": {
  106844. "LUT_INIT": "1100100110011100"
  106845. },
  106846. "attributes": {
  106847. "module_not_derived": "00000000000000000000000000000001",
  106848. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106849. },
  106850. "port_directions": {
  106851. "I0": "input",
  106852. "I1": "input",
  106853. "I2": "input",
  106854. "I3": "input",
  106855. "O": "output"
  106856. },
  106857. "connections": {
  106858. "I0": [ 1254 ],
  106859. "I1": [ 2392 ],
  106860. "I2": [ 4790 ],
  106861. "I3": [ 4791 ],
  106862. "O": [ 2949 ]
  106863. }
  106864. },
  106865. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_14_I2_SB_LUT4_O": {
  106866. "hide_name": 0,
  106867. "type": "SB_LUT4",
  106868. "parameters": {
  106869. "LUT_INIT": "1111000000001111"
  106870. },
  106871. "attributes": {
  106872. "module_not_derived": "00000000000000000000000000000001",
  106873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106874. },
  106875. "port_directions": {
  106876. "I0": "input",
  106877. "I1": "input",
  106878. "I2": "input",
  106879. "I3": "input",
  106880. "O": "output"
  106881. },
  106882. "connections": {
  106883. "I0": [ "0" ],
  106884. "I1": [ "0" ],
  106885. "I2": [ 2991 ],
  106886. "I3": [ 2950 ],
  106887. "O": [ 4790 ]
  106888. }
  106889. },
  106890. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_14_I3_SB_CARRY_CI": {
  106891. "hide_name": 0,
  106892. "type": "SB_CARRY",
  106893. "parameters": {
  106894. },
  106895. "attributes": {
  106896. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  106897. },
  106898. "port_directions": {
  106899. "CI": "input",
  106900. "CO": "output",
  106901. "I0": "input",
  106902. "I1": "input"
  106903. },
  106904. "connections": {
  106905. "CI": [ 4791 ],
  106906. "CO": [ 4792 ],
  106907. "I0": [ 2392 ],
  106908. "I1": [ 4790 ]
  106909. }
  106910. },
  106911. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  106912. "hide_name": 0,
  106913. "type": "SB_CARRY",
  106914. "parameters": {
  106915. },
  106916. "attributes": {
  106917. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  106918. },
  106919. "port_directions": {
  106920. "CI": "input",
  106921. "CO": "output",
  106922. "I0": "input",
  106923. "I1": "input"
  106924. },
  106925. "connections": {
  106926. "CI": [ 4784 ],
  106927. "CO": [ 4791 ],
  106928. "I0": [ 2394 ],
  106929. "I1": [ 4783 ]
  106930. }
  106931. },
  106932. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15": {
  106933. "hide_name": 0,
  106934. "type": "SB_LUT4",
  106935. "parameters": {
  106936. "LUT_INIT": "1100100110011100"
  106937. },
  106938. "attributes": {
  106939. "module_not_derived": "00000000000000000000000000000001",
  106940. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  106941. },
  106942. "port_directions": {
  106943. "I0": "input",
  106944. "I1": "input",
  106945. "I2": "input",
  106946. "I3": "input",
  106947. "O": "output"
  106948. },
  106949. "connections": {
  106950. "I0": [ 1254 ],
  106951. "I1": [ 2384 ],
  106952. "I2": [ 4793 ],
  106953. "I3": [ 4794 ],
  106954. "O": [ 3700 ]
  106955. }
  106956. },
  106957. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O": {
  106958. "hide_name": 0,
  106959. "type": "SB_LUT4",
  106960. "parameters": {
  106961. "LUT_INIT": "1111000000001111"
  106962. },
  106963. "attributes": {
  106964. "module_not_derived": "00000000000000000000000000000001",
  106965. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106966. },
  106967. "port_directions": {
  106968. "I0": "input",
  106969. "I1": "input",
  106970. "I2": "input",
  106971. "I3": "input",
  106972. "O": "output"
  106973. },
  106974. "connections": {
  106975. "I0": [ "0" ],
  106976. "I1": [ "0" ],
  106977. "I2": [ 2991 ],
  106978. "I3": [ 4795 ],
  106979. "O": [ 4793 ]
  106980. }
  106981. },
  106982. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  106983. "hide_name": 0,
  106984. "type": "SB_LUT4",
  106985. "parameters": {
  106986. "LUT_INIT": "1111000000001111"
  106987. },
  106988. "attributes": {
  106989. "module_not_derived": "00000000000000000000000000000001",
  106990. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  106991. },
  106992. "port_directions": {
  106993. "I0": "input",
  106994. "I1": "input",
  106995. "I2": "input",
  106996. "I3": "input",
  106997. "O": "output"
  106998. },
  106999. "connections": {
  107000. "I0": [ "0" ],
  107001. "I1": [ "0" ],
  107002. "I2": [ 2384 ],
  107003. "I3": [ 4795 ],
  107004. "O": [ 4796 ]
  107005. }
  107006. },
  107007. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  107008. "hide_name": 0,
  107009. "type": "SB_LUT4",
  107010. "parameters": {
  107011. "LUT_INIT": "0010111110010010"
  107012. },
  107013. "attributes": {
  107014. "module_not_derived": "00000000000000000000000000000001",
  107015. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107016. },
  107017. "port_directions": {
  107018. "I0": "input",
  107019. "I1": "input",
  107020. "I2": "input",
  107021. "I3": "input",
  107022. "O": "output"
  107023. },
  107024. "connections": {
  107025. "I0": [ 966 ],
  107026. "I1": [ 1250 ],
  107027. "I2": [ 2384 ],
  107028. "I3": [ 4795 ],
  107029. "O": [ 4797 ]
  107030. }
  107031. },
  107032. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  107033. "hide_name": 0,
  107034. "type": "SB_LUT4",
  107035. "parameters": {
  107036. "LUT_INIT": "0110010011111101"
  107037. },
  107038. "attributes": {
  107039. "module_not_derived": "00000000000000000000000000000001",
  107040. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107041. },
  107042. "port_directions": {
  107043. "I0": "input",
  107044. "I1": "input",
  107045. "I2": "input",
  107046. "I3": "input",
  107047. "O": "output"
  107048. },
  107049. "connections": {
  107050. "I0": [ 1246 ],
  107051. "I1": [ 1247 ],
  107052. "I2": [ 4797 ],
  107053. "I3": [ 3700 ],
  107054. "O": [ 2959 ]
  107055. }
  107056. },
  107057. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  107058. "hide_name": 0,
  107059. "type": "SB_LUT4",
  107060. "parameters": {
  107061. "LUT_INIT": "0011111100000000"
  107062. },
  107063. "attributes": {
  107064. "module_not_derived": "00000000000000000000000000000001",
  107065. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107066. },
  107067. "port_directions": {
  107068. "I0": "input",
  107069. "I1": "input",
  107070. "I2": "input",
  107071. "I3": "input",
  107072. "O": "output"
  107073. },
  107074. "connections": {
  107075. "I0": [ "0" ],
  107076. "I1": [ 1179 ],
  107077. "I2": [ 1034 ],
  107078. "I3": [ 4798 ],
  107079. "O": [ 2958 ]
  107080. }
  107081. },
  107082. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  107083. "hide_name": 0,
  107084. "type": "SB_LUT4",
  107085. "parameters": {
  107086. "LUT_INIT": "0001001101011111"
  107087. },
  107088. "attributes": {
  107089. "module_not_derived": "00000000000000000000000000000001",
  107090. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107091. },
  107092. "port_directions": {
  107093. "I0": "input",
  107094. "I1": "input",
  107095. "I2": "input",
  107096. "I3": "input",
  107097. "O": "output"
  107098. },
  107099. "connections": {
  107100. "I0": [ 1119 ],
  107101. "I1": [ 1037 ],
  107102. "I2": [ 1043 ],
  107103. "I3": [ 4799 ],
  107104. "O": [ 4798 ]
  107105. }
  107106. },
  107107. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  107108. "hide_name": 0,
  107109. "type": "SB_DFFER",
  107110. "parameters": {
  107111. },
  107112. "attributes": {
  107113. "module_not_derived": "00000000000000000000000000000001",
  107114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  107115. },
  107116. "port_directions": {
  107117. "C": "input",
  107118. "D": "input",
  107119. "E": "input",
  107120. "Q": "output",
  107121. "R": "input"
  107122. },
  107123. "connections": {
  107124. "C": [ 42 ],
  107125. "D": [ 1231 ],
  107126. "E": [ 1040 ],
  107127. "Q": [ 4799 ],
  107128. "R": [ 127 ]
  107129. }
  107130. },
  107131. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  107132. "hide_name": 0,
  107133. "type": "SB_LUT4",
  107134. "parameters": {
  107135. "LUT_INIT": "0011111100000000"
  107136. },
  107137. "attributes": {
  107138. "module_not_derived": "00000000000000000000000000000001",
  107139. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107140. },
  107141. "port_directions": {
  107142. "I0": "input",
  107143. "I1": "input",
  107144. "I2": "input",
  107145. "I3": "input",
  107146. "O": "output"
  107147. },
  107148. "connections": {
  107149. "I0": [ "0" ],
  107150. "I1": [ 4264 ],
  107151. "I2": [ 2868 ],
  107152. "I3": [ 3017 ],
  107153. "O": [ 4795 ]
  107154. }
  107155. },
  107156. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I3_SB_CARRY_CI": {
  107157. "hide_name": 0,
  107158. "type": "SB_CARRY",
  107159. "parameters": {
  107160. },
  107161. "attributes": {
  107162. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107163. },
  107164. "port_directions": {
  107165. "CI": "input",
  107166. "CO": "output",
  107167. "I0": "input",
  107168. "I1": "input"
  107169. },
  107170. "connections": {
  107171. "CI": [ 4794 ],
  107172. "CO": [ 4800 ],
  107173. "I0": [ 2384 ],
  107174. "I1": [ 4793 ]
  107175. }
  107176. },
  107177. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  107178. "hide_name": 0,
  107179. "type": "SB_CARRY",
  107180. "parameters": {
  107181. },
  107182. "attributes": {
  107183. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107184. },
  107185. "port_directions": {
  107186. "CI": "input",
  107187. "CO": "output",
  107188. "I0": "input",
  107189. "I1": "input"
  107190. },
  107191. "connections": {
  107192. "CI": [ 4792 ],
  107193. "CO": [ 4794 ],
  107194. "I0": [ 2386 ],
  107195. "I1": [ 4801 ]
  107196. }
  107197. },
  107198. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16": {
  107199. "hide_name": 0,
  107200. "type": "SB_LUT4",
  107201. "parameters": {
  107202. "LUT_INIT": "1100100110011100"
  107203. },
  107204. "attributes": {
  107205. "module_not_derived": "00000000000000000000000000000001",
  107206. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107207. },
  107208. "port_directions": {
  107209. "I0": "input",
  107210. "I1": "input",
  107211. "I2": "input",
  107212. "I3": "input",
  107213. "O": "output"
  107214. },
  107215. "connections": {
  107216. "I0": [ 1254 ],
  107217. "I1": [ 2470 ],
  107218. "I2": [ 4802 ],
  107219. "I3": [ 4803 ],
  107220. "O": [ 3078 ]
  107221. }
  107222. },
  107223. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16_I2_SB_CARRY_CO": {
  107224. "hide_name": 0,
  107225. "type": "SB_CARRY",
  107226. "parameters": {
  107227. },
  107228. "attributes": {
  107229. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107230. },
  107231. "port_directions": {
  107232. "CI": "input",
  107233. "CO": "output",
  107234. "I0": "input",
  107235. "I1": "input"
  107236. },
  107237. "connections": {
  107238. "CI": [ 4804 ],
  107239. "CO": [ 4803 ],
  107240. "I0": [ 2991 ],
  107241. "I1": [ 2467 ]
  107242. }
  107243. },
  107244. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16_I2_SB_LUT4_O": {
  107245. "hide_name": 0,
  107246. "type": "SB_LUT4",
  107247. "parameters": {
  107248. "LUT_INIT": "0110110000110011"
  107249. },
  107250. "attributes": {
  107251. "module_not_derived": "00000000000000000000000000000001",
  107252. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107253. },
  107254. "port_directions": {
  107255. "I0": "input",
  107256. "I1": "input",
  107257. "I2": "input",
  107258. "I3": "input",
  107259. "O": "output"
  107260. },
  107261. "connections": {
  107262. "I0": [ 2535 ],
  107263. "I1": [ 2991 ],
  107264. "I2": [ 2536 ],
  107265. "I3": [ 2537 ],
  107266. "O": [ 4802 ]
  107267. }
  107268. },
  107269. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16_I2_SB_LUT4_O_I2_SB_LUT4_O": {
  107270. "hide_name": 0,
  107271. "type": "SB_LUT4",
  107272. "parameters": {
  107273. "LUT_INIT": "1111010100111111"
  107274. },
  107275. "attributes": {
  107276. "module_not_derived": "00000000000000000000000000000001",
  107277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107278. },
  107279. "port_directions": {
  107280. "I0": "input",
  107281. "I1": "input",
  107282. "I2": "input",
  107283. "I3": "input",
  107284. "O": "output"
  107285. },
  107286. "connections": {
  107287. "I0": [ 948 ],
  107288. "I1": [ 976 ],
  107289. "I2": [ 2871 ],
  107290. "I3": [ 2872 ],
  107291. "O": [ 2537 ]
  107292. }
  107293. },
  107294. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16_I2_SB_LUT4_O_I2_SB_LUT4_O_1": {
  107295. "hide_name": 0,
  107296. "type": "SB_LUT4",
  107297. "parameters": {
  107298. "LUT_INIT": "0000000000001111"
  107299. },
  107300. "attributes": {
  107301. "module_not_derived": "00000000000000000000000000000001",
  107302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  107303. },
  107304. "port_directions": {
  107305. "I0": "input",
  107306. "I1": "input",
  107307. "I2": "input",
  107308. "I3": "input",
  107309. "O": "output"
  107310. },
  107311. "connections": {
  107312. "I0": [ "0" ],
  107313. "I1": [ "0" ],
  107314. "I2": [ 2871 ],
  107315. "I3": [ 2872 ],
  107316. "O": [ 2536 ]
  107317. }
  107318. },
  107319. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17": {
  107320. "hide_name": 0,
  107321. "type": "SB_LUT4",
  107322. "parameters": {
  107323. "LUT_INIT": "1100100110011100"
  107324. },
  107325. "attributes": {
  107326. "module_not_derived": "00000000000000000000000000000001",
  107327. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107328. },
  107329. "port_directions": {
  107330. "I0": "input",
  107331. "I1": "input",
  107332. "I2": "input",
  107333. "I3": "input",
  107334. "O": "output"
  107335. },
  107336. "connections": {
  107337. "I0": [ 1254 ],
  107338. "I1": [ 2474 ],
  107339. "I2": [ 4805 ],
  107340. "I3": [ 4806 ],
  107341. "O": [ 2761 ]
  107342. }
  107343. },
  107344. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2_SB_CARRY_CO": {
  107345. "hide_name": 0,
  107346. "type": "SB_CARRY",
  107347. "parameters": {
  107348. },
  107349. "attributes": {
  107350. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107351. },
  107352. "port_directions": {
  107353. "CI": "input",
  107354. "CO": "output",
  107355. "I0": "input",
  107356. "I1": "input"
  107357. },
  107358. "connections": {
  107359. "CI": [ 4803 ],
  107360. "CO": [ 4806 ],
  107361. "I0": [ 2470 ],
  107362. "I1": [ 4802 ]
  107363. }
  107364. },
  107365. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2_SB_LUT4_O": {
  107366. "hide_name": 0,
  107367. "type": "SB_LUT4",
  107368. "parameters": {
  107369. "LUT_INIT": "0101011001010101"
  107370. },
  107371. "attributes": {
  107372. "module_not_derived": "00000000000000000000000000000001",
  107373. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107374. },
  107375. "port_directions": {
  107376. "I0": "input",
  107377. "I1": "input",
  107378. "I2": "input",
  107379. "I3": "input",
  107380. "O": "output"
  107381. },
  107382. "connections": {
  107383. "I0": [ 2991 ],
  107384. "I1": [ 2581 ],
  107385. "I2": [ 2582 ],
  107386. "I3": [ 2583 ],
  107387. "O": [ 4805 ]
  107388. }
  107389. },
  107390. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  107391. "hide_name": 0,
  107392. "type": "SB_LUT4",
  107393. "parameters": {
  107394. "LUT_INIT": "1111010100111111"
  107395. },
  107396. "attributes": {
  107397. "module_not_derived": "00000000000000000000000000000001",
  107398. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107399. },
  107400. "port_directions": {
  107401. "I0": "input",
  107402. "I1": "input",
  107403. "I2": "input",
  107404. "I3": "input",
  107405. "O": "output"
  107406. },
  107407. "connections": {
  107408. "I0": [ 1006 ],
  107409. "I1": [ 974 ],
  107410. "I2": [ 2871 ],
  107411. "I3": [ 2872 ],
  107412. "O": [ 2583 ]
  107413. }
  107414. },
  107415. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_LUT4_O_1": {
  107416. "hide_name": 0,
  107417. "type": "SB_LUT4",
  107418. "parameters": {
  107419. "LUT_INIT": "0000000000001100"
  107420. },
  107421. "attributes": {
  107422. "module_not_derived": "00000000000000000000000000000001",
  107423. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107424. },
  107425. "port_directions": {
  107426. "I0": "input",
  107427. "I1": "input",
  107428. "I2": "input",
  107429. "I3": "input",
  107430. "O": "output"
  107431. },
  107432. "connections": {
  107433. "I0": [ "0" ],
  107434. "I1": [ 3646 ],
  107435. "I2": [ 2871 ],
  107436. "I3": [ 2872 ],
  107437. "O": [ 2581 ]
  107438. }
  107439. },
  107440. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_LUT4_O_2": {
  107441. "hide_name": 0,
  107442. "type": "SB_LUT4",
  107443. "parameters": {
  107444. "LUT_INIT": "1100000000000000"
  107445. },
  107446. "attributes": {
  107447. "module_not_derived": "00000000000000000000000000000001",
  107448. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107449. },
  107450. "port_directions": {
  107451. "I0": "input",
  107452. "I1": "input",
  107453. "I2": "input",
  107454. "I3": "input",
  107455. "O": "output"
  107456. },
  107457. "connections": {
  107458. "I0": [ "0" ],
  107459. "I1": [ 4261 ],
  107460. "I2": [ 2871 ],
  107461. "I3": [ 2872 ],
  107462. "O": [ 2582 ]
  107463. }
  107464. },
  107465. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18": {
  107466. "hide_name": 0,
  107467. "type": "SB_LUT4",
  107468. "parameters": {
  107469. "LUT_INIT": "1100100110011100"
  107470. },
  107471. "attributes": {
  107472. "module_not_derived": "00000000000000000000000000000001",
  107473. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107474. },
  107475. "port_directions": {
  107476. "I0": "input",
  107477. "I1": "input",
  107478. "I2": "input",
  107479. "I3": "input",
  107480. "O": "output"
  107481. },
  107482. "connections": {
  107483. "I0": [ 1254 ],
  107484. "I1": [ 2472 ],
  107485. "I2": [ 4807 ],
  107486. "I3": [ 4808 ],
  107487. "O": [ 2973 ]
  107488. }
  107489. },
  107490. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2_SB_CARRY_CO": {
  107491. "hide_name": 0,
  107492. "type": "SB_CARRY",
  107493. "parameters": {
  107494. },
  107495. "attributes": {
  107496. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107497. },
  107498. "port_directions": {
  107499. "CI": "input",
  107500. "CO": "output",
  107501. "I0": "input",
  107502. "I1": "input"
  107503. },
  107504. "connections": {
  107505. "CI": [ 4806 ],
  107506. "CO": [ 4808 ],
  107507. "I0": [ 2474 ],
  107508. "I1": [ 4805 ]
  107509. }
  107510. },
  107511. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2_SB_LUT4_O": {
  107512. "hide_name": 0,
  107513. "type": "SB_LUT4",
  107514. "parameters": {
  107515. "LUT_INIT": "0101011001010101"
  107516. },
  107517. "attributes": {
  107518. "module_not_derived": "00000000000000000000000000000001",
  107519. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107520. },
  107521. "port_directions": {
  107522. "I0": "input",
  107523. "I1": "input",
  107524. "I2": "input",
  107525. "I3": "input",
  107526. "O": "output"
  107527. },
  107528. "connections": {
  107529. "I0": [ 2991 ],
  107530. "I1": [ 2578 ],
  107531. "I2": [ 2579 ],
  107532. "I3": [ 2580 ],
  107533. "O": [ 4807 ]
  107534. }
  107535. },
  107536. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  107537. "hide_name": 0,
  107538. "type": "SB_LUT4",
  107539. "parameters": {
  107540. "LUT_INIT": "1111010100111111"
  107541. },
  107542. "attributes": {
  107543. "module_not_derived": "00000000000000000000000000000001",
  107544. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107545. },
  107546. "port_directions": {
  107547. "I0": "input",
  107548. "I1": "input",
  107549. "I2": "input",
  107550. "I3": "input",
  107551. "O": "output"
  107552. },
  107553. "connections": {
  107554. "I0": [ 1004 ],
  107555. "I1": [ 972 ],
  107556. "I2": [ 2871 ],
  107557. "I3": [ 2872 ],
  107558. "O": [ 2580 ]
  107559. }
  107560. },
  107561. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_1": {
  107562. "hide_name": 0,
  107563. "type": "SB_LUT4",
  107564. "parameters": {
  107565. "LUT_INIT": "0000000000001100"
  107566. },
  107567. "attributes": {
  107568. "module_not_derived": "00000000000000000000000000000001",
  107569. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107570. },
  107571. "port_directions": {
  107572. "I0": "input",
  107573. "I1": "input",
  107574. "I2": "input",
  107575. "I3": "input",
  107576. "O": "output"
  107577. },
  107578. "connections": {
  107579. "I0": [ "0" ],
  107580. "I1": [ 3650 ],
  107581. "I2": [ 2871 ],
  107582. "I3": [ 2872 ],
  107583. "O": [ 2578 ]
  107584. }
  107585. },
  107586. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_2": {
  107587. "hide_name": 0,
  107588. "type": "SB_LUT4",
  107589. "parameters": {
  107590. "LUT_INIT": "1100000000000000"
  107591. },
  107592. "attributes": {
  107593. "module_not_derived": "00000000000000000000000000000001",
  107594. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107595. },
  107596. "port_directions": {
  107597. "I0": "input",
  107598. "I1": "input",
  107599. "I2": "input",
  107600. "I3": "input",
  107601. "O": "output"
  107602. },
  107603. "connections": {
  107604. "I0": [ "0" ],
  107605. "I1": [ 4260 ],
  107606. "I2": [ 2871 ],
  107607. "I3": [ 2872 ],
  107608. "O": [ 2579 ]
  107609. }
  107610. },
  107611. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19": {
  107612. "hide_name": 0,
  107613. "type": "SB_LUT4",
  107614. "parameters": {
  107615. "LUT_INIT": "1100100110011100"
  107616. },
  107617. "attributes": {
  107618. "module_not_derived": "00000000000000000000000000000001",
  107619. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107620. },
  107621. "port_directions": {
  107622. "I0": "input",
  107623. "I1": "input",
  107624. "I2": "input",
  107625. "I3": "input",
  107626. "O": "output"
  107627. },
  107628. "connections": {
  107629. "I0": [ 1254 ],
  107630. "I1": [ 2380 ],
  107631. "I2": [ 3021 ],
  107632. "I3": [ 3019 ],
  107633. "O": [ 3000 ]
  107634. }
  107635. },
  107636. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2_SB_CARRY_CO": {
  107637. "hide_name": 0,
  107638. "type": "SB_CARRY",
  107639. "parameters": {
  107640. },
  107641. "attributes": {
  107642. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107643. },
  107644. "port_directions": {
  107645. "CI": "input",
  107646. "CO": "output",
  107647. "I0": "input",
  107648. "I1": "input"
  107649. },
  107650. "connections": {
  107651. "CI": [ 4808 ],
  107652. "CO": [ 3019 ],
  107653. "I0": [ 2472 ],
  107654. "I1": [ 4807 ]
  107655. }
  107656. },
  107657. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2_SB_LUT4_O": {
  107658. "hide_name": 0,
  107659. "type": "SB_LUT4",
  107660. "parameters": {
  107661. "LUT_INIT": "0101011001010101"
  107662. },
  107663. "attributes": {
  107664. "module_not_derived": "00000000000000000000000000000001",
  107665. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107666. },
  107667. "port_directions": {
  107668. "I0": "input",
  107669. "I1": "input",
  107670. "I2": "input",
  107671. "I3": "input",
  107672. "O": "output"
  107673. },
  107674. "connections": {
  107675. "I0": [ 2991 ],
  107676. "I1": [ 2564 ],
  107677. "I2": [ 2565 ],
  107678. "I3": [ 2566 ],
  107679. "O": [ 3021 ]
  107680. }
  107681. },
  107682. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2_SB_LUT4_O_I1_SB_LUT4_O": {
  107683. "hide_name": 0,
  107684. "type": "SB_LUT4",
  107685. "parameters": {
  107686. "LUT_INIT": "1111111101010011"
  107687. },
  107688. "attributes": {
  107689. "module_not_derived": "00000000000000000000000000000001",
  107690. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107691. },
  107692. "port_directions": {
  107693. "I0": "input",
  107694. "I1": "input",
  107695. "I2": "input",
  107696. "I3": "input",
  107697. "O": "output"
  107698. },
  107699. "connections": {
  107700. "I0": [ 970 ],
  107701. "I1": [ 3653 ],
  107702. "I2": [ 2871 ],
  107703. "I3": [ 2872 ],
  107704. "O": [ 2566 ]
  107705. }
  107706. },
  107707. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2_SB_LUT4_O_I1_SB_LUT4_O_1": {
  107708. "hide_name": 0,
  107709. "type": "SB_LUT4",
  107710. "parameters": {
  107711. "LUT_INIT": "0000110000000000"
  107712. },
  107713. "attributes": {
  107714. "module_not_derived": "00000000000000000000000000000001",
  107715. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107716. },
  107717. "port_directions": {
  107718. "I0": "input",
  107719. "I1": "input",
  107720. "I2": "input",
  107721. "I3": "input",
  107722. "O": "output"
  107723. },
  107724. "connections": {
  107725. "I0": [ "0" ],
  107726. "I1": [ 1002 ],
  107727. "I2": [ 2871 ],
  107728. "I3": [ 2872 ],
  107729. "O": [ 2564 ]
  107730. }
  107731. },
  107732. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2_SB_LUT4_O_I1_SB_LUT4_O_2": {
  107733. "hide_name": 0,
  107734. "type": "SB_LUT4",
  107735. "parameters": {
  107736. "LUT_INIT": "1100000000000000"
  107737. },
  107738. "attributes": {
  107739. "module_not_derived": "00000000000000000000000000000001",
  107740. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  107741. },
  107742. "port_directions": {
  107743. "I0": "input",
  107744. "I1": "input",
  107745. "I2": "input",
  107746. "I3": "input",
  107747. "O": "output"
  107748. },
  107749. "connections": {
  107750. "I0": [ "0" ],
  107751. "I1": [ 4259 ],
  107752. "I2": [ 2871 ],
  107753. "I3": [ 2872 ],
  107754. "O": [ 2565 ]
  107755. }
  107756. },
  107757. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I1_SB_LUT4_O": {
  107758. "hide_name": 0,
  107759. "type": "SB_LUT4",
  107760. "parameters": {
  107761. "LUT_INIT": "0000101000001100"
  107762. },
  107763. "attributes": {
  107764. "module_not_derived": "00000000000000000000000000000001",
  107765. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107766. },
  107767. "port_directions": {
  107768. "I0": "input",
  107769. "I1": "input",
  107770. "I2": "input",
  107771. "I3": "input",
  107772. "O": "output"
  107773. },
  107774. "connections": {
  107775. "I0": [ 948 ],
  107776. "I1": [ 4038 ],
  107777. "I2": [ 2757 ],
  107778. "I3": [ 2758 ],
  107779. "O": [ 2396 ]
  107780. }
  107781. },
  107782. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I1_SB_LUT4_O_1": {
  107783. "hide_name": 0,
  107784. "type": "SB_LUT4",
  107785. "parameters": {
  107786. "LUT_INIT": "1111000000000000"
  107787. },
  107788. "attributes": {
  107789. "module_not_derived": "00000000000000000000000000000001",
  107790. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  107791. },
  107792. "port_directions": {
  107793. "I0": "input",
  107794. "I1": "input",
  107795. "I2": "input",
  107796. "I3": "input",
  107797. "O": "output"
  107798. },
  107799. "connections": {
  107800. "I0": [ "0" ],
  107801. "I1": [ "0" ],
  107802. "I2": [ 4098 ],
  107803. "I3": [ 2847 ],
  107804. "O": [ 2397 ]
  107805. }
  107806. },
  107807. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I2_SB_LUT4_O": {
  107808. "hide_name": 0,
  107809. "type": "SB_LUT4",
  107810. "parameters": {
  107811. "LUT_INIT": "1111000000001111"
  107812. },
  107813. "attributes": {
  107814. "module_not_derived": "00000000000000000000000000000001",
  107815. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  107816. },
  107817. "port_directions": {
  107818. "I0": "input",
  107819. "I1": "input",
  107820. "I2": "input",
  107821. "I3": "input",
  107822. "O": "output"
  107823. },
  107824. "connections": {
  107825. "I0": [ "0" ],
  107826. "I1": [ "0" ],
  107827. "I2": [ 2991 ],
  107828. "I3": [ 3072 ],
  107829. "O": [ 4762 ]
  107830. }
  107831. },
  107832. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  107833. "hide_name": 0,
  107834. "type": "SB_CARRY",
  107835. "parameters": {
  107836. },
  107837. "attributes": {
  107838. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  107839. },
  107840. "port_directions": {
  107841. "CI": "input",
  107842. "CO": "output",
  107843. "I0": "input",
  107844. "I1": "input"
  107845. },
  107846. "connections": {
  107847. "CI": [ 4761 ],
  107848. "CO": [ 4763 ],
  107849. "I0": [ 2395 ],
  107850. "I1": [ 4760 ]
  107851. }
  107852. },
  107853. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_2": {
  107854. "hide_name": 0,
  107855. "type": "SB_LUT4",
  107856. "parameters": {
  107857. "LUT_INIT": "1100100110011100"
  107858. },
  107859. "attributes": {
  107860. "module_not_derived": "00000000000000000000000000000001",
  107861. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107862. },
  107863. "port_directions": {
  107864. "I0": "input",
  107865. "I1": "input",
  107866. "I2": "input",
  107867. "I3": "input",
  107868. "O": "output"
  107869. },
  107870. "connections": {
  107871. "I0": [ 1254 ],
  107872. "I1": [ 2399 ],
  107873. "I2": [ 4809 ],
  107874. "I3": [ 4810 ],
  107875. "O": [ 2865 ]
  107876. }
  107877. },
  107878. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_20": {
  107879. "hide_name": 0,
  107880. "type": "SB_LUT4",
  107881. "parameters": {
  107882. "LUT_INIT": "1100100110011100"
  107883. },
  107884. "attributes": {
  107885. "module_not_derived": "00000000000000000000000000000001",
  107886. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107887. },
  107888. "port_directions": {
  107889. "I0": "input",
  107890. "I1": "input",
  107891. "I2": "input",
  107892. "I3": "input",
  107893. "O": "output"
  107894. },
  107895. "connections": {
  107896. "I0": [ 1254 ],
  107897. "I1": [ 2383 ],
  107898. "I2": [ 3018 ],
  107899. "I3": [ 3020 ],
  107900. "O": [ 3007 ]
  107901. }
  107902. },
  107903. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_21": {
  107904. "hide_name": 0,
  107905. "type": "SB_LUT4",
  107906. "parameters": {
  107907. "LUT_INIT": "1100100110011100"
  107908. },
  107909. "attributes": {
  107910. "module_not_derived": "00000000000000000000000000000001",
  107911. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107912. },
  107913. "port_directions": {
  107914. "I0": "input",
  107915. "I1": "input",
  107916. "I2": "input",
  107917. "I3": "input",
  107918. "O": "output"
  107919. },
  107920. "connections": {
  107921. "I0": [ 1254 ],
  107922. "I1": [ 2385 ],
  107923. "I2": [ 3031 ],
  107924. "I3": [ 3033 ],
  107925. "O": [ 3029 ]
  107926. }
  107927. },
  107928. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_21_I1_SB_LUT4_O": {
  107929. "hide_name": 0,
  107930. "type": "SB_LUT4",
  107931. "parameters": {
  107932. "LUT_INIT": "0000110000001010"
  107933. },
  107934. "attributes": {
  107935. "module_not_derived": "00000000000000000000000000000001",
  107936. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107937. },
  107938. "port_directions": {
  107939. "I0": "input",
  107940. "I1": "input",
  107941. "I2": "input",
  107942. "I3": "input",
  107943. "O": "output"
  107944. },
  107945. "connections": {
  107946. "I0": [ 4019 ],
  107947. "I1": [ 1000 ],
  107948. "I2": [ 2757 ],
  107949. "I3": [ 2758 ],
  107950. "O": [ 2384 ]
  107951. }
  107952. },
  107953. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_21_I1_SB_LUT4_O_1": {
  107954. "hide_name": 0,
  107955. "type": "SB_LUT4",
  107956. "parameters": {
  107957. "LUT_INIT": "1111000000000000"
  107958. },
  107959. "attributes": {
  107960. "module_not_derived": "00000000000000000000000000000001",
  107961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  107962. },
  107963. "port_directions": {
  107964. "I0": "input",
  107965. "I1": "input",
  107966. "I2": "input",
  107967. "I3": "input",
  107968. "O": "output"
  107969. },
  107970. "connections": {
  107971. "I0": [ "0" ],
  107972. "I1": [ "0" ],
  107973. "I2": [ 4110 ],
  107974. "I3": [ 2847 ],
  107975. "O": [ 2385 ]
  107976. }
  107977. },
  107978. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_22": {
  107979. "hide_name": 0,
  107980. "type": "SB_LUT4",
  107981. "parameters": {
  107982. "LUT_INIT": "1100100110011100"
  107983. },
  107984. "attributes": {
  107985. "module_not_derived": "00000000000000000000000000000001",
  107986. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  107987. },
  107988. "port_directions": {
  107989. "I0": "input",
  107990. "I1": "input",
  107991. "I2": "input",
  107992. "I3": "input",
  107993. "O": "output"
  107994. },
  107995. "connections": {
  107996. "I0": [ 1254 ],
  107997. "I1": [ 2387 ],
  107998. "I2": [ 3043 ],
  107999. "I3": [ 3044 ],
  108000. "O": [ 3040 ]
  108001. }
  108002. },
  108003. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_23": {
  108004. "hide_name": 0,
  108005. "type": "SB_LUT4",
  108006. "parameters": {
  108007. "LUT_INIT": "1100100110011100"
  108008. },
  108009. "attributes": {
  108010. "module_not_derived": "00000000000000000000000000000001",
  108011. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108012. },
  108013. "port_directions": {
  108014. "I0": "input",
  108015. "I1": "input",
  108016. "I2": "input",
  108017. "I3": "input",
  108018. "O": "output"
  108019. },
  108020. "connections": {
  108021. "I0": [ 1254 ],
  108022. "I1": [ 2393 ],
  108023. "I2": [ 3057 ],
  108024. "I3": [ 3058 ],
  108025. "O": [ 3054 ]
  108026. }
  108027. },
  108028. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_23_I1_SB_LUT4_O": {
  108029. "hide_name": 0,
  108030. "type": "SB_LUT4",
  108031. "parameters": {
  108032. "LUT_INIT": "0000101000001100"
  108033. },
  108034. "attributes": {
  108035. "module_not_derived": "00000000000000000000000000000001",
  108036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108037. },
  108038. "port_directions": {
  108039. "I0": "input",
  108040. "I1": "input",
  108041. "I2": "input",
  108042. "I3": "input",
  108043. "O": "output"
  108044. },
  108045. "connections": {
  108046. "I0": [ 1004 ],
  108047. "I1": [ 4028 ],
  108048. "I2": [ 2757 ],
  108049. "I3": [ 2758 ],
  108050. "O": [ 2392 ]
  108051. }
  108052. },
  108053. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_23_I1_SB_LUT4_O_1": {
  108054. "hide_name": 0,
  108055. "type": "SB_LUT4",
  108056. "parameters": {
  108057. "LUT_INIT": "1111000000000000"
  108058. },
  108059. "attributes": {
  108060. "module_not_derived": "00000000000000000000000000000001",
  108061. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  108062. },
  108063. "port_directions": {
  108064. "I0": "input",
  108065. "I1": "input",
  108066. "I2": "input",
  108067. "I3": "input",
  108068. "O": "output"
  108069. },
  108070. "connections": {
  108071. "I0": [ "0" ],
  108072. "I1": [ "0" ],
  108073. "I2": [ 4099 ],
  108074. "I3": [ 2847 ],
  108075. "O": [ 2393 ]
  108076. }
  108077. },
  108078. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24": {
  108079. "hide_name": 0,
  108080. "type": "SB_LUT4",
  108081. "parameters": {
  108082. "LUT_INIT": "1111001111000000"
  108083. },
  108084. "attributes": {
  108085. "module_not_derived": "00000000000000000000000000000001",
  108086. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108087. },
  108088. "port_directions": {
  108089. "I0": "input",
  108090. "I1": "input",
  108091. "I2": "input",
  108092. "I3": "input",
  108093. "O": "output"
  108094. },
  108095. "connections": {
  108096. "I0": [ "0" ],
  108097. "I1": [ 1254 ],
  108098. "I2": [ 2469 ],
  108099. "I3": [ 4811 ],
  108100. "O": [ 3689 ]
  108101. }
  108102. },
  108103. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3": {
  108104. "hide_name": 0,
  108105. "type": "SB_LUT4",
  108106. "parameters": {
  108107. "LUT_INIT": "1100010010000000"
  108108. },
  108109. "attributes": {
  108110. "module_not_derived": "00000000000000000000000000000001",
  108111. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108112. },
  108113. "port_directions": {
  108114. "I0": "input",
  108115. "I1": "input",
  108116. "I2": "input",
  108117. "I3": "input",
  108118. "O": "output"
  108119. },
  108120. "connections": {
  108121. "I0": [ 1254 ],
  108122. "I1": [ 1242 ],
  108123. "I2": [ 2469 ],
  108124. "I3": [ 4811 ],
  108125. "O": [ 4812 ]
  108126. }
  108127. },
  108128. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2": {
  108129. "hide_name": 0,
  108130. "type": "SB_LUT4",
  108131. "parameters": {
  108132. "LUT_INIT": "0000000011111101"
  108133. },
  108134. "attributes": {
  108135. "module_not_derived": "00000000000000000000000000000001",
  108136. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108137. },
  108138. "port_directions": {
  108139. "I0": "input",
  108140. "I1": "input",
  108141. "I2": "input",
  108142. "I3": "input",
  108143. "O": "output"
  108144. },
  108145. "connections": {
  108146. "I0": [ 1246 ],
  108147. "I1": [ 1247 ],
  108148. "I2": [ 4813 ],
  108149. "I3": [ 4812 ],
  108150. "O": [ 2968 ]
  108151. }
  108152. },
  108153. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  108154. "hide_name": 0,
  108155. "type": "SB_LUT4",
  108156. "parameters": {
  108157. "LUT_INIT": "0011111100000000"
  108158. },
  108159. "attributes": {
  108160. "module_not_derived": "00000000000000000000000000000001",
  108161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108162. },
  108163. "port_directions": {
  108164. "I0": "input",
  108165. "I1": "input",
  108166. "I2": "input",
  108167. "I3": "input",
  108168. "O": "output"
  108169. },
  108170. "connections": {
  108171. "I0": [ "0" ],
  108172. "I1": [ 1155 ],
  108173. "I2": [ 1034 ],
  108174. "I3": [ 4814 ],
  108175. "O": [ 2967 ]
  108176. }
  108177. },
  108178. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  108179. "hide_name": 0,
  108180. "type": "SB_LUT4",
  108181. "parameters": {
  108182. "LUT_INIT": "0001001101011111"
  108183. },
  108184. "attributes": {
  108185. "module_not_derived": "00000000000000000000000000000001",
  108186. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108187. },
  108188. "port_directions": {
  108189. "I0": "input",
  108190. "I1": "input",
  108191. "I2": "input",
  108192. "I3": "input",
  108193. "O": "output"
  108194. },
  108195. "connections": {
  108196. "I0": [ 1066 ],
  108197. "I1": [ 1037 ],
  108198. "I2": [ 1043 ],
  108199. "I3": [ 4815 ],
  108200. "O": [ 4814 ]
  108201. }
  108202. },
  108203. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  108204. "hide_name": 0,
  108205. "type": "SB_DFFER",
  108206. "parameters": {
  108207. },
  108208. "attributes": {
  108209. "module_not_derived": "00000000000000000000000000000001",
  108210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  108211. },
  108212. "port_directions": {
  108213. "C": "input",
  108214. "D": "input",
  108215. "E": "input",
  108216. "Q": "output",
  108217. "R": "input"
  108218. },
  108219. "connections": {
  108220. "C": [ 42 ],
  108221. "D": [ 1185 ],
  108222. "E": [ 1040 ],
  108223. "Q": [ 4815 ],
  108224. "R": [ 127 ]
  108225. }
  108226. },
  108227. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  108228. "hide_name": 0,
  108229. "type": "SB_LUT4",
  108230. "parameters": {
  108231. "LUT_INIT": "0010111110010010"
  108232. },
  108233. "attributes": {
  108234. "module_not_derived": "00000000000000000000000000000001",
  108235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108236. },
  108237. "port_directions": {
  108238. "I0": "input",
  108239. "I1": "input",
  108240. "I2": "input",
  108241. "I3": "input",
  108242. "O": "output"
  108243. },
  108244. "connections": {
  108245. "I0": [ 966 ],
  108246. "I1": [ 1250 ],
  108247. "I2": [ 2469 ],
  108248. "I3": [ 4816 ],
  108249. "O": [ 4813 ]
  108250. }
  108251. },
  108252. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2": {
  108253. "hide_name": 0,
  108254. "type": "SB_LUT4",
  108255. "parameters": {
  108256. "LUT_INIT": "0001001001001000"
  108257. },
  108258. "attributes": {
  108259. "module_not_derived": "00000000000000000000000000000001",
  108260. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108261. },
  108262. "port_directions": {
  108263. "I0": "input",
  108264. "I1": "input",
  108265. "I2": "input",
  108266. "I3": "input",
  108267. "O": "output"
  108268. },
  108269. "connections": {
  108270. "I0": [ 2469 ],
  108271. "I1": [ 2395 ],
  108272. "I2": [ 4816 ],
  108273. "I3": [ 4817 ],
  108274. "O": [ 4818 ]
  108275. }
  108276. },
  108277. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3": {
  108278. "hide_name": 0,
  108279. "type": "SB_LUT4",
  108280. "parameters": {
  108281. "LUT_INIT": "1111000000001111"
  108282. },
  108283. "attributes": {
  108284. "module_not_derived": "00000000000000000000000000000001",
  108285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  108286. },
  108287. "port_directions": {
  108288. "I0": "input",
  108289. "I1": "input",
  108290. "I2": "input",
  108291. "I3": "input",
  108292. "O": "output"
  108293. },
  108294. "connections": {
  108295. "I0": [ "0" ],
  108296. "I1": [ "0" ],
  108297. "I2": [ 2991 ],
  108298. "I3": [ 4817 ],
  108299. "O": [ 4760 ]
  108300. }
  108301. },
  108302. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1": {
  108303. "hide_name": 0,
  108304. "type": "SB_LUT4",
  108305. "parameters": {
  108306. "LUT_INIT": "0010111110010010"
  108307. },
  108308. "attributes": {
  108309. "module_not_derived": "00000000000000000000000000000001",
  108310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108311. },
  108312. "port_directions": {
  108313. "I0": "input",
  108314. "I1": "input",
  108315. "I2": "input",
  108316. "I3": "input",
  108317. "O": "output"
  108318. },
  108319. "connections": {
  108320. "I0": [ 966 ],
  108321. "I1": [ 1250 ],
  108322. "I2": [ 2395 ],
  108323. "I3": [ 4817 ],
  108324. "O": [ 4819 ]
  108325. }
  108326. },
  108327. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  108328. "hide_name": 0,
  108329. "type": "SB_LUT4",
  108330. "parameters": {
  108331. "LUT_INIT": "0110010011111101"
  108332. },
  108333. "attributes": {
  108334. "module_not_derived": "00000000000000000000000000000001",
  108335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108336. },
  108337. "port_directions": {
  108338. "I0": "input",
  108339. "I1": "input",
  108340. "I2": "input",
  108341. "I3": "input",
  108342. "O": "output"
  108343. },
  108344. "connections": {
  108345. "I0": [ 1246 ],
  108346. "I1": [ 1247 ],
  108347. "I2": [ 4819 ],
  108348. "I3": [ 3696 ],
  108349. "O": [ 3063 ]
  108350. }
  108351. },
  108352. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  108353. "hide_name": 0,
  108354. "type": "SB_LUT4",
  108355. "parameters": {
  108356. "LUT_INIT": "0011111100000000"
  108357. },
  108358. "attributes": {
  108359. "module_not_derived": "00000000000000000000000000000001",
  108360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108361. },
  108362. "port_directions": {
  108363. "I0": "input",
  108364. "I1": "input",
  108365. "I2": "input",
  108366. "I3": "input",
  108367. "O": "output"
  108368. },
  108369. "connections": {
  108370. "I0": [ "0" ],
  108371. "I1": [ 1168 ],
  108372. "I2": [ 1034 ],
  108373. "I3": [ 4820 ],
  108374. "O": [ 3062 ]
  108375. }
  108376. },
  108377. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  108378. "hide_name": 0,
  108379. "type": "SB_LUT4",
  108380. "parameters": {
  108381. "LUT_INIT": "0001001101011111"
  108382. },
  108383. "attributes": {
  108384. "module_not_derived": "00000000000000000000000000000001",
  108385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108386. },
  108387. "port_directions": {
  108388. "I0": "input",
  108389. "I1": "input",
  108390. "I2": "input",
  108391. "I3": "input",
  108392. "O": "output"
  108393. },
  108394. "connections": {
  108395. "I0": [ 1094 ],
  108396. "I1": [ 1037 ],
  108397. "I2": [ 1043 ],
  108398. "I3": [ 4821 ],
  108399. "O": [ 4820 ]
  108400. }
  108401. },
  108402. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  108403. "hide_name": 0,
  108404. "type": "SB_DFFER",
  108405. "parameters": {
  108406. },
  108407. "attributes": {
  108408. "module_not_derived": "00000000000000000000000000000001",
  108409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  108410. },
  108411. "port_directions": {
  108412. "C": "input",
  108413. "D": "input",
  108414. "E": "input",
  108415. "Q": "output",
  108416. "R": "input"
  108417. },
  108418. "connections": {
  108419. "C": [ 42 ],
  108420. "D": [ 1211 ],
  108421. "E": [ 1040 ],
  108422. "Q": [ 4821 ],
  108423. "R": [ 127 ]
  108424. }
  108425. },
  108426. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_O_SB_CARRY_CO": {
  108427. "hide_name": 0,
  108428. "type": "SB_CARRY",
  108429. "parameters": {
  108430. },
  108431. "attributes": {
  108432. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  108433. },
  108434. "port_directions": {
  108435. "CI": "input",
  108436. "CO": "output",
  108437. "I0": "input",
  108438. "I1": "input"
  108439. },
  108440. "connections": {
  108441. "CI": [ 3058 ],
  108442. "CO": [ 4761 ],
  108443. "I0": [ 2393 ],
  108444. "I1": [ 3057 ]
  108445. }
  108446. },
  108447. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_O": {
  108448. "hide_name": 0,
  108449. "type": "SB_LUT4",
  108450. "parameters": {
  108451. "LUT_INIT": "0011111100000000"
  108452. },
  108453. "attributes": {
  108454. "module_not_derived": "00000000000000000000000000000001",
  108455. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108456. },
  108457. "port_directions": {
  108458. "I0": "input",
  108459. "I1": "input",
  108460. "I2": "input",
  108461. "I3": "input",
  108462. "O": "output"
  108463. },
  108464. "connections": {
  108465. "I0": [ "0" ],
  108466. "I1": [ 4258 ],
  108467. "I2": [ 2868 ],
  108468. "I3": [ 4822 ],
  108469. "O": [ 4817 ]
  108470. }
  108471. },
  108472. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  108473. "hide_name": 0,
  108474. "type": "SB_LUT4",
  108475. "parameters": {
  108476. "LUT_INIT": "1111010101010011"
  108477. },
  108478. "attributes": {
  108479. "module_not_derived": "00000000000000000000000000000001",
  108480. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108481. },
  108482. "port_directions": {
  108483. "I0": "input",
  108484. "I1": "input",
  108485. "I2": "input",
  108486. "I3": "input",
  108487. "O": "output"
  108488. },
  108489. "connections": {
  108490. "I0": [ 968 ],
  108491. "I1": [ 3641 ],
  108492. "I2": [ 2871 ],
  108493. "I3": [ 2872 ],
  108494. "O": [ 4822 ]
  108495. }
  108496. },
  108497. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O": {
  108498. "hide_name": 0,
  108499. "type": "SB_LUT4",
  108500. "parameters": {
  108501. "LUT_INIT": "0011111100000000"
  108502. },
  108503. "attributes": {
  108504. "module_not_derived": "00000000000000000000000000000001",
  108505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108506. },
  108507. "port_directions": {
  108508. "I0": "input",
  108509. "I1": "input",
  108510. "I2": "input",
  108511. "I3": "input",
  108512. "O": "output"
  108513. },
  108514. "connections": {
  108515. "I0": [ "0" ],
  108516. "I1": [ 4250 ],
  108517. "I2": [ 2868 ],
  108518. "I3": [ 4823 ],
  108519. "O": [ 4816 ]
  108520. }
  108521. },
  108522. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  108523. "hide_name": 0,
  108524. "type": "SB_LUT4",
  108525. "parameters": {
  108526. "LUT_INIT": "1111010101010011"
  108527. },
  108528. "attributes": {
  108529. "module_not_derived": "00000000000000000000000000000001",
  108530. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108531. },
  108532. "port_directions": {
  108533. "I0": "input",
  108534. "I1": "input",
  108535. "I2": "input",
  108536. "I3": "input",
  108537. "O": "output"
  108538. },
  108539. "connections": {
  108540. "I0": [ 943 ],
  108541. "I1": [ 3658 ],
  108542. "I2": [ 2871 ],
  108543. "I3": [ 2872 ],
  108544. "O": [ 4823 ]
  108545. }
  108546. },
  108547. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O": {
  108548. "hide_name": 0,
  108549. "type": "SB_LUT4",
  108550. "parameters": {
  108551. "LUT_INIT": "0110100110010110"
  108552. },
  108553. "attributes": {
  108554. "module_not_derived": "00000000000000000000000000000001",
  108555. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108556. },
  108557. "port_directions": {
  108558. "I0": "input",
  108559. "I1": "input",
  108560. "I2": "input",
  108561. "I3": "input",
  108562. "O": "output"
  108563. },
  108564. "connections": {
  108565. "I0": [ "0" ],
  108566. "I1": [ 2469 ],
  108567. "I2": [ 4824 ],
  108568. "I3": [ 4825 ],
  108569. "O": [ 4811 ]
  108570. }
  108571. },
  108572. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  108573. "hide_name": 0,
  108574. "type": "SB_LUT4",
  108575. "parameters": {
  108576. "LUT_INIT": "1111000000001111"
  108577. },
  108578. "attributes": {
  108579. "module_not_derived": "00000000000000000000000000000001",
  108580. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  108581. },
  108582. "port_directions": {
  108583. "I0": "input",
  108584. "I1": "input",
  108585. "I2": "input",
  108586. "I3": "input",
  108587. "O": "output"
  108588. },
  108589. "connections": {
  108590. "I0": [ "0" ],
  108591. "I1": [ "0" ],
  108592. "I2": [ 2991 ],
  108593. "I3": [ 4816 ],
  108594. "O": [ 4824 ]
  108595. }
  108596. },
  108597. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CI": {
  108598. "hide_name": 0,
  108599. "type": "SB_CARRY",
  108600. "parameters": {
  108601. },
  108602. "attributes": {
  108603. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  108604. },
  108605. "port_directions": {
  108606. "CI": "input",
  108607. "CO": "output",
  108608. "I0": "input",
  108609. "I1": "input"
  108610. },
  108611. "connections": {
  108612. "CI": [ 4825 ],
  108613. "CO": [ 4826 ],
  108614. "I0": [ 2469 ],
  108615. "I1": [ 4824 ]
  108616. }
  108617. },
  108618. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3": {
  108619. "hide_name": 0,
  108620. "type": "SB_LUT4",
  108621. "parameters": {
  108622. "LUT_INIT": "1001011001101001"
  108623. },
  108624. "attributes": {
  108625. "module_not_derived": "00000000000000000000000000000001",
  108626. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108627. },
  108628. "port_directions": {
  108629. "I0": "input",
  108630. "I1": "input",
  108631. "I2": "input",
  108632. "I3": "input",
  108633. "O": "output"
  108634. },
  108635. "connections": {
  108636. "I0": [ 2991 ],
  108637. "I1": [ 1251 ],
  108638. "I2": [ 1252 ],
  108639. "I3": [ 4826 ],
  108640. "O": [ 1255 ]
  108641. }
  108642. },
  108643. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O": {
  108644. "hide_name": 0,
  108645. "type": "SB_LUT4",
  108646. "parameters": {
  108647. "LUT_INIT": "1111000000001111"
  108648. },
  108649. "attributes": {
  108650. "module_not_derived": "00000000000000000000000000000001",
  108651. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  108652. },
  108653. "port_directions": {
  108654. "I0": "input",
  108655. "I1": "input",
  108656. "I2": "input",
  108657. "I3": "input",
  108658. "O": "output"
  108659. },
  108660. "connections": {
  108661. "I0": [ "0" ],
  108662. "I1": [ "0" ],
  108663. "I2": [ 1251 ],
  108664. "I3": [ 1252 ],
  108665. "O": [ 4281 ]
  108666. }
  108667. },
  108668. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  108669. "hide_name": 0,
  108670. "type": "SB_CARRY",
  108671. "parameters": {
  108672. },
  108673. "attributes": {
  108674. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  108675. },
  108676. "port_directions": {
  108677. "CI": "input",
  108678. "CO": "output",
  108679. "I0": "input",
  108680. "I1": "input"
  108681. },
  108682. "connections": {
  108683. "CI": [ 4827 ],
  108684. "CO": [ 4825 ],
  108685. "I0": [ 2473 ],
  108686. "I1": [ 4828 ]
  108687. }
  108688. },
  108689. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  108690. "hide_name": 0,
  108691. "type": "SB_CARRY",
  108692. "parameters": {
  108693. },
  108694. "attributes": {
  108695. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  108696. },
  108697. "port_directions": {
  108698. "CI": "input",
  108699. "CO": "output",
  108700. "I0": "input",
  108701. "I1": "input"
  108702. },
  108703. "connections": {
  108704. "CI": [ 2990 ],
  108705. "CO": [ 4827 ],
  108706. "I0": [ 2471 ],
  108707. "I1": [ 2989 ]
  108708. }
  108709. },
  108710. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2": {
  108711. "hide_name": 0,
  108712. "type": "SB_LUT4",
  108713. "parameters": {
  108714. "LUT_INIT": "0110100110010110"
  108715. },
  108716. "attributes": {
  108717. "module_not_derived": "00000000000000000000000000000001",
  108718. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108719. },
  108720. "port_directions": {
  108721. "I0": "input",
  108722. "I1": "input",
  108723. "I2": "input",
  108724. "I3": "input",
  108725. "O": "output"
  108726. },
  108727. "connections": {
  108728. "I0": [ "0" ],
  108729. "I1": [ 2473 ],
  108730. "I2": [ 4828 ],
  108731. "I3": [ 4827 ],
  108732. "O": [ 4829 ]
  108733. }
  108734. },
  108735. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3": {
  108736. "hide_name": 0,
  108737. "type": "SB_LUT4",
  108738. "parameters": {
  108739. "LUT_INIT": "1100010010000000"
  108740. },
  108741. "attributes": {
  108742. "module_not_derived": "00000000000000000000000000000001",
  108743. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108744. },
  108745. "port_directions": {
  108746. "I0": "input",
  108747. "I1": "input",
  108748. "I2": "input",
  108749. "I3": "input",
  108750. "O": "output"
  108751. },
  108752. "connections": {
  108753. "I0": [ 1254 ],
  108754. "I1": [ 1242 ],
  108755. "I2": [ 2473 ],
  108756. "I3": [ 4829 ],
  108757. "O": [ 2979 ]
  108758. }
  108759. },
  108760. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O": {
  108761. "hide_name": 0,
  108762. "type": "SB_LUT4",
  108763. "parameters": {
  108764. "LUT_INIT": "0000000000001100"
  108765. },
  108766. "attributes": {
  108767. "module_not_derived": "00000000000000000000000000000001",
  108768. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108769. },
  108770. "port_directions": {
  108771. "I0": "input",
  108772. "I1": "input",
  108773. "I2": "input",
  108774. "I3": "input",
  108775. "O": "output"
  108776. },
  108777. "connections": {
  108778. "I0": [ "0" ],
  108779. "I1": [ 1246 ],
  108780. "I2": [ 1247 ],
  108781. "I3": [ 4830 ],
  108782. "O": [ 2978 ]
  108783. }
  108784. },
  108785. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O_1": {
  108786. "hide_name": 0,
  108787. "type": "SB_LUT4",
  108788. "parameters": {
  108789. "LUT_INIT": "0011111100000000"
  108790. },
  108791. "attributes": {
  108792. "module_not_derived": "00000000000000000000000000000001",
  108793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108794. },
  108795. "port_directions": {
  108796. "I0": "input",
  108797. "I1": "input",
  108798. "I2": "input",
  108799. "I3": "input",
  108800. "O": "output"
  108801. },
  108802. "connections": {
  108803. "I0": [ "0" ],
  108804. "I1": [ 1166 ],
  108805. "I2": [ 1034 ],
  108806. "I3": [ 4831 ],
  108807. "O": [ 2977 ]
  108808. }
  108809. },
  108810. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3_SB_LUT4_O": {
  108811. "hide_name": 0,
  108812. "type": "SB_LUT4",
  108813. "parameters": {
  108814. "LUT_INIT": "0001001101011111"
  108815. },
  108816. "attributes": {
  108817. "module_not_derived": "00000000000000000000000000000001",
  108818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108819. },
  108820. "port_directions": {
  108821. "I0": "input",
  108822. "I1": "input",
  108823. "I2": "input",
  108824. "I3": "input",
  108825. "O": "output"
  108826. },
  108827. "connections": {
  108828. "I0": [ 1088 ],
  108829. "I1": [ 1037 ],
  108830. "I2": [ 1043 ],
  108831. "I3": [ 4832 ],
  108832. "O": [ 4831 ]
  108833. }
  108834. },
  108835. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  108836. "hide_name": 0,
  108837. "type": "SB_DFFER",
  108838. "parameters": {
  108839. },
  108840. "attributes": {
  108841. "module_not_derived": "00000000000000000000000000000001",
  108842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  108843. },
  108844. "port_directions": {
  108845. "C": "input",
  108846. "D": "input",
  108847. "E": "input",
  108848. "Q": "output",
  108849. "R": "input"
  108850. },
  108851. "connections": {
  108852. "C": [ 42 ],
  108853. "D": [ 1206 ],
  108854. "E": [ 1040 ],
  108855. "Q": [ 4832 ],
  108856. "R": [ 127 ]
  108857. }
  108858. },
  108859. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O": {
  108860. "hide_name": 0,
  108861. "type": "SB_LUT4",
  108862. "parameters": {
  108863. "LUT_INIT": "1111000000001111"
  108864. },
  108865. "attributes": {
  108866. "module_not_derived": "00000000000000000000000000000001",
  108867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  108868. },
  108869. "port_directions": {
  108870. "I0": "input",
  108871. "I1": "input",
  108872. "I2": "input",
  108873. "I3": "input",
  108874. "O": "output"
  108875. },
  108876. "connections": {
  108877. "I0": [ "0" ],
  108878. "I1": [ "0" ],
  108879. "I2": [ 2991 ],
  108880. "I3": [ 3073 ],
  108881. "O": [ 4828 ]
  108882. }
  108883. },
  108884. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3_SB_LUT4_I3": {
  108885. "hide_name": 0,
  108886. "type": "SB_LUT4",
  108887. "parameters": {
  108888. "LUT_INIT": "0010111110010010"
  108889. },
  108890. "attributes": {
  108891. "module_not_derived": "00000000000000000000000000000001",
  108892. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108893. },
  108894. "port_directions": {
  108895. "I0": "input",
  108896. "I1": "input",
  108897. "I2": "input",
  108898. "I3": "input",
  108899. "O": "output"
  108900. },
  108901. "connections": {
  108902. "I0": [ 966 ],
  108903. "I1": [ 1250 ],
  108904. "I2": [ 2473 ],
  108905. "I3": [ 3073 ],
  108906. "O": [ 4830 ]
  108907. }
  108908. },
  108909. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3_SB_LUT4_O": {
  108910. "hide_name": 0,
  108911. "type": "SB_LUT4",
  108912. "parameters": {
  108913. "LUT_INIT": "0011111100000000"
  108914. },
  108915. "attributes": {
  108916. "module_not_derived": "00000000000000000000000000000001",
  108917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108918. },
  108919. "port_directions": {
  108920. "I0": "input",
  108921. "I1": "input",
  108922. "I2": "input",
  108923. "I3": "input",
  108924. "O": "output"
  108925. },
  108926. "connections": {
  108927. "I0": [ "0" ],
  108928. "I1": [ 4257 ],
  108929. "I2": [ 2868 ],
  108930. "I3": [ 4833 ],
  108931. "O": [ 3073 ]
  108932. }
  108933. },
  108934. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  108935. "hide_name": 0,
  108936. "type": "SB_LUT4",
  108937. "parameters": {
  108938. "LUT_INIT": "1111010101010011"
  108939. },
  108940. "attributes": {
  108941. "module_not_derived": "00000000000000000000000000000001",
  108942. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108943. },
  108944. "port_directions": {
  108945. "I0": "input",
  108946. "I1": "input",
  108947. "I2": "input",
  108948. "I3": "input",
  108949. "O": "output"
  108950. },
  108951. "connections": {
  108952. "I0": [ 943 ],
  108953. "I1": [ 3654 ],
  108954. "I2": [ 2871 ],
  108955. "I3": [ 2872 ],
  108956. "O": [ 4833 ]
  108957. }
  108958. },
  108959. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25": {
  108960. "hide_name": 0,
  108961. "type": "SB_LUT4",
  108962. "parameters": {
  108963. "LUT_INIT": "1111001111000000"
  108964. },
  108965. "attributes": {
  108966. "module_not_derived": "00000000000000000000000000000001",
  108967. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  108968. },
  108969. "port_directions": {
  108970. "I0": "input",
  108971. "I1": "input",
  108972. "I2": "input",
  108973. "I3": "input",
  108974. "O": "output"
  108975. },
  108976. "connections": {
  108977. "I0": [ "0" ],
  108978. "I1": [ 1254 ],
  108979. "I2": [ 2379 ],
  108980. "I3": [ 4834 ],
  108981. "O": [ 3695 ]
  108982. }
  108983. },
  108984. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3": {
  108985. "hide_name": 0,
  108986. "type": "SB_LUT4",
  108987. "parameters": {
  108988. "LUT_INIT": "1100010010000000"
  108989. },
  108990. "attributes": {
  108991. "module_not_derived": "00000000000000000000000000000001",
  108992. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  108993. },
  108994. "port_directions": {
  108995. "I0": "input",
  108996. "I1": "input",
  108997. "I2": "input",
  108998. "I3": "input",
  108999. "O": "output"
  109000. },
  109001. "connections": {
  109002. "I0": [ 1254 ],
  109003. "I1": [ 1242 ],
  109004. "I2": [ 2379 ],
  109005. "I3": [ 4834 ],
  109006. "O": [ 4835 ]
  109007. }
  109008. },
  109009. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2": {
  109010. "hide_name": 0,
  109011. "type": "SB_LUT4",
  109012. "parameters": {
  109013. "LUT_INIT": "0000000011111101"
  109014. },
  109015. "attributes": {
  109016. "module_not_derived": "00000000000000000000000000000001",
  109017. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109018. },
  109019. "port_directions": {
  109020. "I0": "input",
  109021. "I1": "input",
  109022. "I2": "input",
  109023. "I3": "input",
  109024. "O": "output"
  109025. },
  109026. "connections": {
  109027. "I0": [ 1246 ],
  109028. "I1": [ 1247 ],
  109029. "I2": [ 4836 ],
  109030. "I3": [ 4835 ],
  109031. "O": [ 2965 ]
  109032. }
  109033. },
  109034. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  109035. "hide_name": 0,
  109036. "type": "SB_LUT4",
  109037. "parameters": {
  109038. "LUT_INIT": "0011111100000000"
  109039. },
  109040. "attributes": {
  109041. "module_not_derived": "00000000000000000000000000000001",
  109042. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109043. },
  109044. "port_directions": {
  109045. "I0": "input",
  109046. "I1": "input",
  109047. "I2": "input",
  109048. "I3": "input",
  109049. "O": "output"
  109050. },
  109051. "connections": {
  109052. "I0": [ "0" ],
  109053. "I1": [ 1177 ],
  109054. "I2": [ 1034 ],
  109055. "I3": [ 4837 ],
  109056. "O": [ 2964 ]
  109057. }
  109058. },
  109059. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  109060. "hide_name": 0,
  109061. "type": "SB_LUT4",
  109062. "parameters": {
  109063. "LUT_INIT": "0001001101011111"
  109064. },
  109065. "attributes": {
  109066. "module_not_derived": "00000000000000000000000000000001",
  109067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109068. },
  109069. "port_directions": {
  109070. "I0": "input",
  109071. "I1": "input",
  109072. "I2": "input",
  109073. "I3": "input",
  109074. "O": "output"
  109075. },
  109076. "connections": {
  109077. "I0": [ 1115 ],
  109078. "I1": [ 1037 ],
  109079. "I2": [ 1043 ],
  109080. "I3": [ 4838 ],
  109081. "O": [ 4837 ]
  109082. }
  109083. },
  109084. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  109085. "hide_name": 0,
  109086. "type": "SB_DFFER",
  109087. "parameters": {
  109088. },
  109089. "attributes": {
  109090. "module_not_derived": "00000000000000000000000000000001",
  109091. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  109092. },
  109093. "port_directions": {
  109094. "C": "input",
  109095. "D": "input",
  109096. "E": "input",
  109097. "Q": "output",
  109098. "R": "input"
  109099. },
  109100. "connections": {
  109101. "C": [ 42 ],
  109102. "D": [ 1227 ],
  109103. "E": [ 1040 ],
  109104. "Q": [ 4838 ],
  109105. "R": [ 127 ]
  109106. }
  109107. },
  109108. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  109109. "hide_name": 0,
  109110. "type": "SB_LUT4",
  109111. "parameters": {
  109112. "LUT_INIT": "0010111110010010"
  109113. },
  109114. "attributes": {
  109115. "module_not_derived": "00000000000000000000000000000001",
  109116. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109117. },
  109118. "port_directions": {
  109119. "I0": "input",
  109120. "I1": "input",
  109121. "I2": "input",
  109122. "I3": "input",
  109123. "O": "output"
  109124. },
  109125. "connections": {
  109126. "I0": [ 966 ],
  109127. "I1": [ 1250 ],
  109128. "I2": [ 2379 ],
  109129. "I3": [ 4839 ],
  109130. "O": [ 4836 ]
  109131. }
  109132. },
  109133. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I3": {
  109134. "hide_name": 0,
  109135. "type": "SB_LUT4",
  109136. "parameters": {
  109137. "LUT_INIT": "1111000000001111"
  109138. },
  109139. "attributes": {
  109140. "module_not_derived": "00000000000000000000000000000001",
  109141. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  109142. },
  109143. "port_directions": {
  109144. "I0": "input",
  109145. "I1": "input",
  109146. "I2": "input",
  109147. "I3": "input",
  109148. "O": "output"
  109149. },
  109150. "connections": {
  109151. "I0": [ "0" ],
  109152. "I1": [ "0" ],
  109153. "I2": [ 2379 ],
  109154. "I3": [ 4839 ],
  109155. "O": [ 4840 ]
  109156. }
  109157. },
  109158. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O": {
  109159. "hide_name": 0,
  109160. "type": "SB_LUT4",
  109161. "parameters": {
  109162. "LUT_INIT": "0011111100000000"
  109163. },
  109164. "attributes": {
  109165. "module_not_derived": "00000000000000000000000000000001",
  109166. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109167. },
  109168. "port_directions": {
  109169. "I0": "input",
  109170. "I1": "input",
  109171. "I2": "input",
  109172. "I3": "input",
  109173. "O": "output"
  109174. },
  109175. "connections": {
  109176. "I0": [ "0" ],
  109177. "I1": [ 4262 ],
  109178. "I2": [ 2868 ],
  109179. "I3": [ 4841 ],
  109180. "O": [ 4839 ]
  109181. }
  109182. },
  109183. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  109184. "hide_name": 0,
  109185. "type": "SB_LUT4",
  109186. "parameters": {
  109187. "LUT_INIT": "1111010101010011"
  109188. },
  109189. "attributes": {
  109190. "module_not_derived": "00000000000000000000000000000001",
  109191. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109192. },
  109193. "port_directions": {
  109194. "I0": "input",
  109195. "I1": "input",
  109196. "I2": "input",
  109197. "I3": "input",
  109198. "O": "output"
  109199. },
  109200. "connections": {
  109201. "I0": [ 943 ],
  109202. "I1": [ 3647 ],
  109203. "I2": [ 2871 ],
  109204. "I3": [ 2872 ],
  109205. "O": [ 4841 ]
  109206. }
  109207. },
  109208. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_O": {
  109209. "hide_name": 0,
  109210. "type": "SB_LUT4",
  109211. "parameters": {
  109212. "LUT_INIT": "0110100110010110"
  109213. },
  109214. "attributes": {
  109215. "module_not_derived": "00000000000000000000000000000001",
  109216. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109217. },
  109218. "port_directions": {
  109219. "I0": "input",
  109220. "I1": "input",
  109221. "I2": "input",
  109222. "I3": "input",
  109223. "O": "output"
  109224. },
  109225. "connections": {
  109226. "I0": [ "0" ],
  109227. "I1": [ 2379 ],
  109228. "I2": [ 4842 ],
  109229. "I3": [ 4843 ],
  109230. "O": [ 4834 ]
  109231. }
  109232. },
  109233. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  109234. "hide_name": 0,
  109235. "type": "SB_LUT4",
  109236. "parameters": {
  109237. "LUT_INIT": "1111000000001111"
  109238. },
  109239. "attributes": {
  109240. "module_not_derived": "00000000000000000000000000000001",
  109241. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  109242. },
  109243. "port_directions": {
  109244. "I0": "input",
  109245. "I1": "input",
  109246. "I2": "input",
  109247. "I3": "input",
  109248. "O": "output"
  109249. },
  109250. "connections": {
  109251. "I0": [ "0" ],
  109252. "I1": [ "0" ],
  109253. "I2": [ 2991 ],
  109254. "I3": [ 4839 ],
  109255. "O": [ 4842 ]
  109256. }
  109257. },
  109258. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_CARRY_CI": {
  109259. "hide_name": 0,
  109260. "type": "SB_CARRY",
  109261. "parameters": {
  109262. },
  109263. "attributes": {
  109264. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  109265. },
  109266. "port_directions": {
  109267. "CI": "input",
  109268. "CO": "output",
  109269. "I0": "input",
  109270. "I1": "input"
  109271. },
  109272. "connections": {
  109273. "CI": [ 4843 ],
  109274. "CO": [ 2990 ],
  109275. "I0": [ 2379 ],
  109276. "I1": [ 4842 ]
  109277. }
  109278. },
  109279. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  109280. "hide_name": 0,
  109281. "type": "SB_CARRY",
  109282. "parameters": {
  109283. },
  109284. "attributes": {
  109285. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  109286. },
  109287. "port_directions": {
  109288. "CI": "input",
  109289. "CO": "output",
  109290. "I0": "input",
  109291. "I1": "input"
  109292. },
  109293. "connections": {
  109294. "CI": [ 4800 ],
  109295. "CO": [ 4843 ],
  109296. "I0": [ 2382 ],
  109297. "I1": [ 4844 ]
  109298. }
  109299. },
  109300. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26": {
  109301. "hide_name": 0,
  109302. "type": "SB_LUT4",
  109303. "parameters": {
  109304. "LUT_INIT": "1111001111000000"
  109305. },
  109306. "attributes": {
  109307. "module_not_derived": "00000000000000000000000000000001",
  109308. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109309. },
  109310. "port_directions": {
  109311. "I0": "input",
  109312. "I1": "input",
  109313. "I2": "input",
  109314. "I3": "input",
  109315. "O": "output"
  109316. },
  109317. "connections": {
  109318. "I0": [ "0" ],
  109319. "I1": [ 1254 ],
  109320. "I2": [ 2382 ],
  109321. "I3": [ 4845 ],
  109322. "O": [ 3699 ]
  109323. }
  109324. },
  109325. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I2_SB_LUT4_O": {
  109326. "hide_name": 0,
  109327. "type": "SB_LUT4",
  109328. "parameters": {
  109329. "LUT_INIT": "0000101000001100"
  109330. },
  109331. "attributes": {
  109332. "module_not_derived": "00000000000000000000000000000001",
  109333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109334. },
  109335. "port_directions": {
  109336. "I0": "input",
  109337. "I1": "input",
  109338. "I2": "input",
  109339. "I3": "input",
  109340. "O": "output"
  109341. },
  109342. "connections": {
  109343. "I0": [ 998 ],
  109344. "I1": [ 4014 ],
  109345. "I2": [ 2757 ],
  109346. "I3": [ 2758 ],
  109347. "O": [ 2382 ]
  109348. }
  109349. },
  109350. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I2_SB_LUT4_O_1": {
  109351. "hide_name": 0,
  109352. "type": "SB_LUT4",
  109353. "parameters": {
  109354. "LUT_INIT": "1111000000000000"
  109355. },
  109356. "attributes": {
  109357. "module_not_derived": "00000000000000000000000000000001",
  109358. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  109359. },
  109360. "port_directions": {
  109361. "I0": "input",
  109362. "I1": "input",
  109363. "I2": "input",
  109364. "I3": "input",
  109365. "O": "output"
  109366. },
  109367. "connections": {
  109368. "I0": [ "0" ],
  109369. "I1": [ "0" ],
  109370. "I2": [ 4115 ],
  109371. "I3": [ 2847 ],
  109372. "O": [ 2383 ]
  109373. }
  109374. },
  109375. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3": {
  109376. "hide_name": 0,
  109377. "type": "SB_LUT4",
  109378. "parameters": {
  109379. "LUT_INIT": "1100010010000000"
  109380. },
  109381. "attributes": {
  109382. "module_not_derived": "00000000000000000000000000000001",
  109383. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109384. },
  109385. "port_directions": {
  109386. "I0": "input",
  109387. "I1": "input",
  109388. "I2": "input",
  109389. "I3": "input",
  109390. "O": "output"
  109391. },
  109392. "connections": {
  109393. "I0": [ 1254 ],
  109394. "I1": [ 1242 ],
  109395. "I2": [ 2382 ],
  109396. "I3": [ 4845 ],
  109397. "O": [ 4846 ]
  109398. }
  109399. },
  109400. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2": {
  109401. "hide_name": 0,
  109402. "type": "SB_LUT4",
  109403. "parameters": {
  109404. "LUT_INIT": "0000000011111101"
  109405. },
  109406. "attributes": {
  109407. "module_not_derived": "00000000000000000000000000000001",
  109408. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109409. },
  109410. "port_directions": {
  109411. "I0": "input",
  109412. "I1": "input",
  109413. "I2": "input",
  109414. "I3": "input",
  109415. "O": "output"
  109416. },
  109417. "connections": {
  109418. "I0": [ 1246 ],
  109419. "I1": [ 1247 ],
  109420. "I2": [ 4847 ],
  109421. "I3": [ 4846 ],
  109422. "O": [ 2962 ]
  109423. }
  109424. },
  109425. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  109426. "hide_name": 0,
  109427. "type": "SB_LUT4",
  109428. "parameters": {
  109429. "LUT_INIT": "0011111100000000"
  109430. },
  109431. "attributes": {
  109432. "module_not_derived": "00000000000000000000000000000001",
  109433. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109434. },
  109435. "port_directions": {
  109436. "I0": "input",
  109437. "I1": "input",
  109438. "I2": "input",
  109439. "I3": "input",
  109440. "O": "output"
  109441. },
  109442. "connections": {
  109443. "I0": [ "0" ],
  109444. "I1": [ 1178 ],
  109445. "I2": [ 1034 ],
  109446. "I3": [ 4848 ],
  109447. "O": [ 2961 ]
  109448. }
  109449. },
  109450. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  109451. "hide_name": 0,
  109452. "type": "SB_LUT4",
  109453. "parameters": {
  109454. "LUT_INIT": "0001001101011111"
  109455. },
  109456. "attributes": {
  109457. "module_not_derived": "00000000000000000000000000000001",
  109458. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109459. },
  109460. "port_directions": {
  109461. "I0": "input",
  109462. "I1": "input",
  109463. "I2": "input",
  109464. "I3": "input",
  109465. "O": "output"
  109466. },
  109467. "connections": {
  109468. "I0": [ 1117 ],
  109469. "I1": [ 1037 ],
  109470. "I2": [ 1043 ],
  109471. "I3": [ 4849 ],
  109472. "O": [ 4848 ]
  109473. }
  109474. },
  109475. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  109476. "hide_name": 0,
  109477. "type": "SB_DFFER",
  109478. "parameters": {
  109479. },
  109480. "attributes": {
  109481. "module_not_derived": "00000000000000000000000000000001",
  109482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  109483. },
  109484. "port_directions": {
  109485. "C": "input",
  109486. "D": "input",
  109487. "E": "input",
  109488. "Q": "output",
  109489. "R": "input"
  109490. },
  109491. "connections": {
  109492. "C": [ 42 ],
  109493. "D": [ 1229 ],
  109494. "E": [ 1040 ],
  109495. "Q": [ 4849 ],
  109496. "R": [ 127 ]
  109497. }
  109498. },
  109499. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  109500. "hide_name": 0,
  109501. "type": "SB_LUT4",
  109502. "parameters": {
  109503. "LUT_INIT": "0010111110010010"
  109504. },
  109505. "attributes": {
  109506. "module_not_derived": "00000000000000000000000000000001",
  109507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109508. },
  109509. "port_directions": {
  109510. "I0": "input",
  109511. "I1": "input",
  109512. "I2": "input",
  109513. "I3": "input",
  109514. "O": "output"
  109515. },
  109516. "connections": {
  109517. "I0": [ 966 ],
  109518. "I1": [ 1250 ],
  109519. "I2": [ 2382 ],
  109520. "I3": [ 4850 ],
  109521. "O": [ 4847 ]
  109522. }
  109523. },
  109524. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I3": {
  109525. "hide_name": 0,
  109526. "type": "SB_LUT4",
  109527. "parameters": {
  109528. "LUT_INIT": "1111000000001111"
  109529. },
  109530. "attributes": {
  109531. "module_not_derived": "00000000000000000000000000000001",
  109532. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  109533. },
  109534. "port_directions": {
  109535. "I0": "input",
  109536. "I1": "input",
  109537. "I2": "input",
  109538. "I3": "input",
  109539. "O": "output"
  109540. },
  109541. "connections": {
  109542. "I0": [ "0" ],
  109543. "I1": [ "0" ],
  109544. "I2": [ 2382 ],
  109545. "I3": [ 4850 ],
  109546. "O": [ 4299 ]
  109547. }
  109548. },
  109549. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O": {
  109550. "hide_name": 0,
  109551. "type": "SB_LUT4",
  109552. "parameters": {
  109553. "LUT_INIT": "0011111100000000"
  109554. },
  109555. "attributes": {
  109556. "module_not_derived": "00000000000000000000000000000001",
  109557. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109558. },
  109559. "port_directions": {
  109560. "I0": "input",
  109561. "I1": "input",
  109562. "I2": "input",
  109563. "I3": "input",
  109564. "O": "output"
  109565. },
  109566. "connections": {
  109567. "I0": [ "0" ],
  109568. "I1": [ 4263 ],
  109569. "I2": [ 2868 ],
  109570. "I3": [ 4851 ],
  109571. "O": [ 4850 ]
  109572. }
  109573. },
  109574. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  109575. "hide_name": 0,
  109576. "type": "SB_LUT4",
  109577. "parameters": {
  109578. "LUT_INIT": "1111010101010011"
  109579. },
  109580. "attributes": {
  109581. "module_not_derived": "00000000000000000000000000000001",
  109582. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109583. },
  109584. "port_directions": {
  109585. "I0": "input",
  109586. "I1": "input",
  109587. "I2": "input",
  109588. "I3": "input",
  109589. "O": "output"
  109590. },
  109591. "connections": {
  109592. "I0": [ 943 ],
  109593. "I1": [ 3643 ],
  109594. "I2": [ 2871 ],
  109595. "I3": [ 2872 ],
  109596. "O": [ 4851 ]
  109597. }
  109598. },
  109599. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_O": {
  109600. "hide_name": 0,
  109601. "type": "SB_LUT4",
  109602. "parameters": {
  109603. "LUT_INIT": "0110100110010110"
  109604. },
  109605. "attributes": {
  109606. "module_not_derived": "00000000000000000000000000000001",
  109607. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109608. },
  109609. "port_directions": {
  109610. "I0": "input",
  109611. "I1": "input",
  109612. "I2": "input",
  109613. "I3": "input",
  109614. "O": "output"
  109615. },
  109616. "connections": {
  109617. "I0": [ "0" ],
  109618. "I1": [ 2382 ],
  109619. "I2": [ 4844 ],
  109620. "I3": [ 4800 ],
  109621. "O": [ 4845 ]
  109622. }
  109623. },
  109624. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  109625. "hide_name": 0,
  109626. "type": "SB_LUT4",
  109627. "parameters": {
  109628. "LUT_INIT": "1111000000001111"
  109629. },
  109630. "attributes": {
  109631. "module_not_derived": "00000000000000000000000000000001",
  109632. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  109633. },
  109634. "port_directions": {
  109635. "I0": "input",
  109636. "I1": "input",
  109637. "I2": "input",
  109638. "I3": "input",
  109639. "O": "output"
  109640. },
  109641. "connections": {
  109642. "I0": [ "0" ],
  109643. "I1": [ "0" ],
  109644. "I2": [ 2991 ],
  109645. "I3": [ 4850 ],
  109646. "O": [ 4844 ]
  109647. }
  109648. },
  109649. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27": {
  109650. "hide_name": 0,
  109651. "type": "SB_LUT4",
  109652. "parameters": {
  109653. "LUT_INIT": "1111001111000000"
  109654. },
  109655. "attributes": {
  109656. "module_not_derived": "00000000000000000000000000000001",
  109657. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109658. },
  109659. "port_directions": {
  109660. "I0": "input",
  109661. "I1": "input",
  109662. "I2": "input",
  109663. "I3": "input",
  109664. "O": "output"
  109665. },
  109666. "connections": {
  109667. "I0": [ "0" ],
  109668. "I1": [ 1254 ],
  109669. "I2": [ 2386 ],
  109670. "I3": [ 4852 ],
  109671. "O": [ 3701 ]
  109672. }
  109673. },
  109674. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3": {
  109675. "hide_name": 0,
  109676. "type": "SB_LUT4",
  109677. "parameters": {
  109678. "LUT_INIT": "1100010010000000"
  109679. },
  109680. "attributes": {
  109681. "module_not_derived": "00000000000000000000000000000001",
  109682. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109683. },
  109684. "port_directions": {
  109685. "I0": "input",
  109686. "I1": "input",
  109687. "I2": "input",
  109688. "I3": "input",
  109689. "O": "output"
  109690. },
  109691. "connections": {
  109692. "I0": [ 1254 ],
  109693. "I1": [ 1242 ],
  109694. "I2": [ 2386 ],
  109695. "I3": [ 4852 ],
  109696. "O": [ 4853 ]
  109697. }
  109698. },
  109699. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2": {
  109700. "hide_name": 0,
  109701. "type": "SB_LUT4",
  109702. "parameters": {
  109703. "LUT_INIT": "0000000011111101"
  109704. },
  109705. "attributes": {
  109706. "module_not_derived": "00000000000000000000000000000001",
  109707. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109708. },
  109709. "port_directions": {
  109710. "I0": "input",
  109711. "I1": "input",
  109712. "I2": "input",
  109713. "I3": "input",
  109714. "O": "output"
  109715. },
  109716. "connections": {
  109717. "I0": [ 1246 ],
  109718. "I1": [ 1247 ],
  109719. "I2": [ 4854 ],
  109720. "I3": [ 4853 ],
  109721. "O": [ 2956 ]
  109722. }
  109723. },
  109724. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  109725. "hide_name": 0,
  109726. "type": "SB_LUT4",
  109727. "parameters": {
  109728. "LUT_INIT": "0011111100000000"
  109729. },
  109730. "attributes": {
  109731. "module_not_derived": "00000000000000000000000000000001",
  109732. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109733. },
  109734. "port_directions": {
  109735. "I0": "input",
  109736. "I1": "input",
  109737. "I2": "input",
  109738. "I3": "input",
  109739. "O": "output"
  109740. },
  109741. "connections": {
  109742. "I0": [ "0" ],
  109743. "I1": [ 1180 ],
  109744. "I2": [ 1034 ],
  109745. "I3": [ 4855 ],
  109746. "O": [ 2955 ]
  109747. }
  109748. },
  109749. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  109750. "hide_name": 0,
  109751. "type": "SB_LUT4",
  109752. "parameters": {
  109753. "LUT_INIT": "0001001101011111"
  109754. },
  109755. "attributes": {
  109756. "module_not_derived": "00000000000000000000000000000001",
  109757. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109758. },
  109759. "port_directions": {
  109760. "I0": "input",
  109761. "I1": "input",
  109762. "I2": "input",
  109763. "I3": "input",
  109764. "O": "output"
  109765. },
  109766. "connections": {
  109767. "I0": [ 1121 ],
  109768. "I1": [ 1037 ],
  109769. "I2": [ 1043 ],
  109770. "I3": [ 4856 ],
  109771. "O": [ 4855 ]
  109772. }
  109773. },
  109774. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  109775. "hide_name": 0,
  109776. "type": "SB_DFFER",
  109777. "parameters": {
  109778. },
  109779. "attributes": {
  109780. "module_not_derived": "00000000000000000000000000000001",
  109781. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  109782. },
  109783. "port_directions": {
  109784. "C": "input",
  109785. "D": "input",
  109786. "E": "input",
  109787. "Q": "output",
  109788. "R": "input"
  109789. },
  109790. "connections": {
  109791. "C": [ 42 ],
  109792. "D": [ 1233 ],
  109793. "E": [ 1040 ],
  109794. "Q": [ 4856 ],
  109795. "R": [ 127 ]
  109796. }
  109797. },
  109798. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  109799. "hide_name": 0,
  109800. "type": "SB_LUT4",
  109801. "parameters": {
  109802. "LUT_INIT": "0010111110010010"
  109803. },
  109804. "attributes": {
  109805. "module_not_derived": "00000000000000000000000000000001",
  109806. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109807. },
  109808. "port_directions": {
  109809. "I0": "input",
  109810. "I1": "input",
  109811. "I2": "input",
  109812. "I3": "input",
  109813. "O": "output"
  109814. },
  109815. "connections": {
  109816. "I0": [ 966 ],
  109817. "I1": [ 1250 ],
  109818. "I2": [ 2386 ],
  109819. "I3": [ 4857 ],
  109820. "O": [ 4854 ]
  109821. }
  109822. },
  109823. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O": {
  109824. "hide_name": 0,
  109825. "type": "SB_LUT4",
  109826. "parameters": {
  109827. "LUT_INIT": "0110100110010110"
  109828. },
  109829. "attributes": {
  109830. "module_not_derived": "00000000000000000000000000000001",
  109831. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109832. },
  109833. "port_directions": {
  109834. "I0": "input",
  109835. "I1": "input",
  109836. "I2": "input",
  109837. "I3": "input",
  109838. "O": "output"
  109839. },
  109840. "connections": {
  109841. "I0": [ "0" ],
  109842. "I1": [ 2386 ],
  109843. "I2": [ 4801 ],
  109844. "I3": [ 4792 ],
  109845. "O": [ 4852 ]
  109846. }
  109847. },
  109848. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  109849. "hide_name": 0,
  109850. "type": "SB_LUT4",
  109851. "parameters": {
  109852. "LUT_INIT": "1111000000001111"
  109853. },
  109854. "attributes": {
  109855. "module_not_derived": "00000000000000000000000000000001",
  109856. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  109857. },
  109858. "port_directions": {
  109859. "I0": "input",
  109860. "I1": "input",
  109861. "I2": "input",
  109862. "I3": "input",
  109863. "O": "output"
  109864. },
  109865. "connections": {
  109866. "I0": [ "0" ],
  109867. "I1": [ "0" ],
  109868. "I2": [ 2991 ],
  109869. "I3": [ 4857 ],
  109870. "O": [ 4801 ]
  109871. }
  109872. },
  109873. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I1": {
  109874. "hide_name": 0,
  109875. "type": "SB_LUT4",
  109876. "parameters": {
  109877. "LUT_INIT": "0000011000000000"
  109878. },
  109879. "attributes": {
  109880. "module_not_derived": "00000000000000000000000000000001",
  109881. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109882. },
  109883. "port_directions": {
  109884. "I0": "input",
  109885. "I1": "input",
  109886. "I2": "input",
  109887. "I3": "input",
  109888. "O": "output"
  109889. },
  109890. "connections": {
  109891. "I0": [ 2386 ],
  109892. "I1": [ 4857 ],
  109893. "I2": [ 4840 ],
  109894. "I3": [ 3042 ],
  109895. "O": [ 4300 ]
  109896. }
  109897. },
  109898. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  109899. "hide_name": 0,
  109900. "type": "SB_LUT4",
  109901. "parameters": {
  109902. "LUT_INIT": "0011111100000000"
  109903. },
  109904. "attributes": {
  109905. "module_not_derived": "00000000000000000000000000000001",
  109906. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109907. },
  109908. "port_directions": {
  109909. "I0": "input",
  109910. "I1": "input",
  109911. "I2": "input",
  109912. "I3": "input",
  109913. "O": "output"
  109914. },
  109915. "connections": {
  109916. "I0": [ "0" ],
  109917. "I1": [ 4265 ],
  109918. "I2": [ 2868 ],
  109919. "I3": [ 4858 ],
  109920. "O": [ 4857 ]
  109921. }
  109922. },
  109923. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  109924. "hide_name": 0,
  109925. "type": "SB_LUT4",
  109926. "parameters": {
  109927. "LUT_INIT": "1111010101010011"
  109928. },
  109929. "attributes": {
  109930. "module_not_derived": "00000000000000000000000000000001",
  109931. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109932. },
  109933. "port_directions": {
  109934. "I0": "input",
  109935. "I1": "input",
  109936. "I2": "input",
  109937. "I3": "input",
  109938. "O": "output"
  109939. },
  109940. "connections": {
  109941. "I0": [ 943 ],
  109942. "I1": [ 3684 ],
  109943. "I2": [ 2871 ],
  109944. "I3": [ 2872 ],
  109945. "O": [ 4858 ]
  109946. }
  109947. },
  109948. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28": {
  109949. "hide_name": 0,
  109950. "type": "SB_LUT4",
  109951. "parameters": {
  109952. "LUT_INIT": "1111001111000000"
  109953. },
  109954. "attributes": {
  109955. "module_not_derived": "00000000000000000000000000000001",
  109956. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  109957. },
  109958. "port_directions": {
  109959. "I0": "input",
  109960. "I1": "input",
  109961. "I2": "input",
  109962. "I3": "input",
  109963. "O": "output"
  109964. },
  109965. "connections": {
  109966. "I0": [ "0" ],
  109967. "I1": [ 1254 ],
  109968. "I2": [ 2467 ],
  109969. "I3": [ 2781 ],
  109970. "O": [ 2775 ]
  109971. }
  109972. },
  109973. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O": {
  109974. "hide_name": 0,
  109975. "type": "SB_LUT4",
  109976. "parameters": {
  109977. "LUT_INIT": "0110100110010110"
  109978. },
  109979. "attributes": {
  109980. "module_not_derived": "00000000000000000000000000000001",
  109981. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  109982. },
  109983. "port_directions": {
  109984. "I0": "input",
  109985. "I1": "input",
  109986. "I2": "input",
  109987. "I3": "input",
  109988. "O": "output"
  109989. },
  109990. "connections": {
  109991. "I0": [ "0" ],
  109992. "I1": [ 2991 ],
  109993. "I2": [ 2467 ],
  109994. "I3": [ 4804 ],
  109995. "O": [ 2781 ]
  109996. }
  109997. },
  109998. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_1": {
  109999. "hide_name": 0,
  110000. "type": "SB_LUT4",
  110001. "parameters": {
  110002. "LUT_INIT": "0100000001100100"
  110003. },
  110004. "attributes": {
  110005. "module_not_derived": "00000000000000000000000000000001",
  110006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110007. },
  110008. "port_directions": {
  110009. "I0": "input",
  110010. "I1": "input",
  110011. "I2": "input",
  110012. "I3": "input",
  110013. "O": "output"
  110014. },
  110015. "connections": {
  110016. "I0": [ 966 ],
  110017. "I1": [ 1250 ],
  110018. "I2": [ 2467 ],
  110019. "I3": [ 2372 ],
  110020. "O": [ 2782 ]
  110021. }
  110022. },
  110023. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  110024. "hide_name": 0,
  110025. "type": "SB_LUT4",
  110026. "parameters": {
  110027. "LUT_INIT": "0110110000110011"
  110028. },
  110029. "attributes": {
  110030. "module_not_derived": "00000000000000000000000000000001",
  110031. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110032. },
  110033. "port_directions": {
  110034. "I0": "input",
  110035. "I1": "input",
  110036. "I2": "input",
  110037. "I3": "input",
  110038. "O": "output"
  110039. },
  110040. "connections": {
  110041. "I0": [ 3639 ],
  110042. "I1": [ 2991 ],
  110043. "I2": [ 2536 ],
  110044. "I3": [ 4859 ],
  110045. "O": [ 4804 ]
  110046. }
  110047. },
  110048. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3": {
  110049. "hide_name": 0,
  110050. "type": "SB_LUT4",
  110051. "parameters": {
  110052. "LUT_INIT": "0011111100000000"
  110053. },
  110054. "attributes": {
  110055. "module_not_derived": "00000000000000000000000000000001",
  110056. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110057. },
  110058. "port_directions": {
  110059. "I0": "input",
  110060. "I1": "input",
  110061. "I2": "input",
  110062. "I3": "input",
  110063. "O": "output"
  110064. },
  110065. "connections": {
  110066. "I0": [ "0" ],
  110067. "I1": [ 3639 ],
  110068. "I2": [ 2536 ],
  110069. "I3": [ 4859 ],
  110070. "O": [ 2372 ]
  110071. }
  110072. },
  110073. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  110074. "hide_name": 0,
  110075. "type": "SB_LUT4",
  110076. "parameters": {
  110077. "LUT_INIT": "0000110000111111"
  110078. },
  110079. "attributes": {
  110080. "module_not_derived": "00000000000000000000000000000001",
  110081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110082. },
  110083. "port_directions": {
  110084. "I0": "input",
  110085. "I1": "input",
  110086. "I2": "input",
  110087. "I3": "input",
  110088. "O": "output"
  110089. },
  110090. "connections": {
  110091. "I0": [ "0" ],
  110092. "I1": [ 2378 ],
  110093. "I2": [ 2382 ],
  110094. "I3": [ 2383 ],
  110095. "O": [ 2532 ]
  110096. }
  110097. },
  110098. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O_1": {
  110099. "hide_name": 0,
  110100. "type": "SB_LUT4",
  110101. "parameters": {
  110102. "LUT_INIT": "0000110000111111"
  110103. },
  110104. "attributes": {
  110105. "module_not_derived": "00000000000000000000000000000001",
  110106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110107. },
  110108. "port_directions": {
  110109. "I0": "input",
  110110. "I1": "input",
  110111. "I2": "input",
  110112. "I3": "input",
  110113. "O": "output"
  110114. },
  110115. "connections": {
  110116. "I0": [ "0" ],
  110117. "I1": [ 2378 ],
  110118. "I2": [ 2379 ],
  110119. "I3": [ 2380 ],
  110120. "O": [ 2466 ]
  110121. }
  110122. },
  110123. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  110124. "hide_name": 0,
  110125. "type": "SB_LUT4",
  110126. "parameters": {
  110127. "LUT_INIT": "1111010100111111"
  110128. },
  110129. "attributes": {
  110130. "module_not_derived": "00000000000000000000000000000001",
  110131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110132. },
  110133. "port_directions": {
  110134. "I0": "input",
  110135. "I1": "input",
  110136. "I2": "input",
  110137. "I3": "input",
  110138. "O": "output"
  110139. },
  110140. "connections": {
  110141. "I0": [ 950 ],
  110142. "I1": [ 978 ],
  110143. "I2": [ 2871 ],
  110144. "I3": [ 2872 ],
  110145. "O": [ 4859 ]
  110146. }
  110147. },
  110148. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_2_I2_SB_LUT4_O": {
  110149. "hide_name": 0,
  110150. "type": "SB_LUT4",
  110151. "parameters": {
  110152. "LUT_INIT": "1111000000001111"
  110153. },
  110154. "attributes": {
  110155. "module_not_derived": "00000000000000000000000000000001",
  110156. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110157. },
  110158. "port_directions": {
  110159. "I0": "input",
  110160. "I1": "input",
  110161. "I2": "input",
  110162. "I3": "input",
  110163. "O": "output"
  110164. },
  110165. "connections": {
  110166. "I0": [ "0" ],
  110167. "I1": [ "0" ],
  110168. "I2": [ 2991 ],
  110169. "I3": [ 2866 ],
  110170. "O": [ 4809 ]
  110171. }
  110172. },
  110173. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  110174. "hide_name": 0,
  110175. "type": "SB_CARRY",
  110176. "parameters": {
  110177. },
  110178. "attributes": {
  110179. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  110180. },
  110181. "port_directions": {
  110182. "CI": "input",
  110183. "CO": "output",
  110184. "I0": "input",
  110185. "I1": "input"
  110186. },
  110187. "connections": {
  110188. "CI": [ 4763 ],
  110189. "CO": [ 4810 ],
  110190. "I0": [ 2397 ],
  110191. "I1": [ 4762 ]
  110192. }
  110193. },
  110194. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_3": {
  110195. "hide_name": 0,
  110196. "type": "SB_LUT4",
  110197. "parameters": {
  110198. "LUT_INIT": "1100100110011100"
  110199. },
  110200. "attributes": {
  110201. "module_not_derived": "00000000000000000000000000000001",
  110202. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110203. },
  110204. "port_directions": {
  110205. "I0": "input",
  110206. "I1": "input",
  110207. "I2": "input",
  110208. "I3": "input",
  110209. "O": "output"
  110210. },
  110211. "connections": {
  110212. "I0": [ 1254 ],
  110213. "I1": [ 2522 ],
  110214. "I2": [ 4860 ],
  110215. "I3": [ 4861 ],
  110216. "O": [ 2877 ]
  110217. }
  110218. },
  110219. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_3_I2_SB_LUT4_O": {
  110220. "hide_name": 0,
  110221. "type": "SB_LUT4",
  110222. "parameters": {
  110223. "LUT_INIT": "1111000000001111"
  110224. },
  110225. "attributes": {
  110226. "module_not_derived": "00000000000000000000000000000001",
  110227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110228. },
  110229. "port_directions": {
  110230. "I0": "input",
  110231. "I1": "input",
  110232. "I2": "input",
  110233. "I3": "input",
  110234. "O": "output"
  110235. },
  110236. "connections": {
  110237. "I0": [ "0" ],
  110238. "I1": [ "0" ],
  110239. "I2": [ 2991 ],
  110240. "I3": [ 2878 ],
  110241. "O": [ 4860 ]
  110242. }
  110243. },
  110244. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  110245. "hide_name": 0,
  110246. "type": "SB_CARRY",
  110247. "parameters": {
  110248. },
  110249. "attributes": {
  110250. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  110251. },
  110252. "port_directions": {
  110253. "CI": "input",
  110254. "CO": "output",
  110255. "I0": "input",
  110256. "I1": "input"
  110257. },
  110258. "connections": {
  110259. "CI": [ 4810 ],
  110260. "CO": [ 4861 ],
  110261. "I0": [ 2399 ],
  110262. "I1": [ 4809 ]
  110263. }
  110264. },
  110265. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4": {
  110266. "hide_name": 0,
  110267. "type": "SB_LUT4",
  110268. "parameters": {
  110269. "LUT_INIT": "1100100110011100"
  110270. },
  110271. "attributes": {
  110272. "module_not_derived": "00000000000000000000000000000001",
  110273. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110274. },
  110275. "port_directions": {
  110276. "I0": "input",
  110277. "I1": "input",
  110278. "I2": "input",
  110279. "I3": "input",
  110280. "O": "output"
  110281. },
  110282. "connections": {
  110283. "I0": [ 1254 ],
  110284. "I1": [ 2524 ],
  110285. "I2": [ 4862 ],
  110286. "I3": [ 4863 ],
  110287. "O": [ 3694 ]
  110288. }
  110289. },
  110290. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O": {
  110291. "hide_name": 0,
  110292. "type": "SB_LUT4",
  110293. "parameters": {
  110294. "LUT_INIT": "1111000000001111"
  110295. },
  110296. "attributes": {
  110297. "module_not_derived": "00000000000000000000000000000001",
  110298. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110299. },
  110300. "port_directions": {
  110301. "I0": "input",
  110302. "I1": "input",
  110303. "I2": "input",
  110304. "I3": "input",
  110305. "O": "output"
  110306. },
  110307. "connections": {
  110308. "I0": [ "0" ],
  110309. "I1": [ "0" ],
  110310. "I2": [ 2991 ],
  110311. "I3": [ 4864 ],
  110312. "O": [ 4862 ]
  110313. }
  110314. },
  110315. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  110316. "hide_name": 0,
  110317. "type": "SB_LUT4",
  110318. "parameters": {
  110319. "LUT_INIT": "1111000000001111"
  110320. },
  110321. "attributes": {
  110322. "module_not_derived": "00000000000000000000000000000001",
  110323. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110324. },
  110325. "port_directions": {
  110326. "I0": "input",
  110327. "I1": "input",
  110328. "I2": "input",
  110329. "I3": "input",
  110330. "O": "output"
  110331. },
  110332. "connections": {
  110333. "I0": [ "0" ],
  110334. "I1": [ "0" ],
  110335. "I2": [ 2524 ],
  110336. "I3": [ 4864 ],
  110337. "O": [ 4865 ]
  110338. }
  110339. },
  110340. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  110341. "hide_name": 0,
  110342. "type": "SB_LUT4",
  110343. "parameters": {
  110344. "LUT_INIT": "0010111110010010"
  110345. },
  110346. "attributes": {
  110347. "module_not_derived": "00000000000000000000000000000001",
  110348. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110349. },
  110350. "port_directions": {
  110351. "I0": "input",
  110352. "I1": "input",
  110353. "I2": "input",
  110354. "I3": "input",
  110355. "O": "output"
  110356. },
  110357. "connections": {
  110358. "I0": [ 966 ],
  110359. "I1": [ 1250 ],
  110360. "I2": [ 2524 ],
  110361. "I3": [ 4864 ],
  110362. "O": [ 4866 ]
  110363. }
  110364. },
  110365. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  110366. "hide_name": 0,
  110367. "type": "SB_LUT4",
  110368. "parameters": {
  110369. "LUT_INIT": "0110010011111101"
  110370. },
  110371. "attributes": {
  110372. "module_not_derived": "00000000000000000000000000000001",
  110373. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110374. },
  110375. "port_directions": {
  110376. "I0": "input",
  110377. "I1": "input",
  110378. "I2": "input",
  110379. "I3": "input",
  110380. "O": "output"
  110381. },
  110382. "connections": {
  110383. "I0": [ 1246 ],
  110384. "I1": [ 1247 ],
  110385. "I2": [ 4866 ],
  110386. "I3": [ 3694 ],
  110387. "O": [ 2884 ]
  110388. }
  110389. },
  110390. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  110391. "hide_name": 0,
  110392. "type": "SB_LUT4",
  110393. "parameters": {
  110394. "LUT_INIT": "0011111100000000"
  110395. },
  110396. "attributes": {
  110397. "module_not_derived": "00000000000000000000000000000001",
  110398. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110399. },
  110400. "port_directions": {
  110401. "I0": "input",
  110402. "I1": "input",
  110403. "I2": "input",
  110404. "I3": "input",
  110405. "O": "output"
  110406. },
  110407. "connections": {
  110408. "I0": [ "0" ],
  110409. "I1": [ 1164 ],
  110410. "I2": [ 1034 ],
  110411. "I3": [ 4867 ],
  110412. "O": [ 2883 ]
  110413. }
  110414. },
  110415. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  110416. "hide_name": 0,
  110417. "type": "SB_LUT4",
  110418. "parameters": {
  110419. "LUT_INIT": "0001001101011111"
  110420. },
  110421. "attributes": {
  110422. "module_not_derived": "00000000000000000000000000000001",
  110423. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110424. },
  110425. "port_directions": {
  110426. "I0": "input",
  110427. "I1": "input",
  110428. "I2": "input",
  110429. "I3": "input",
  110430. "O": "output"
  110431. },
  110432. "connections": {
  110433. "I0": [ 1084 ],
  110434. "I1": [ 1037 ],
  110435. "I2": [ 1043 ],
  110436. "I3": [ 4868 ],
  110437. "O": [ 4867 ]
  110438. }
  110439. },
  110440. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  110441. "hide_name": 0,
  110442. "type": "SB_DFFER",
  110443. "parameters": {
  110444. },
  110445. "attributes": {
  110446. "module_not_derived": "00000000000000000000000000000001",
  110447. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  110448. },
  110449. "port_directions": {
  110450. "C": "input",
  110451. "D": "input",
  110452. "E": "input",
  110453. "Q": "output",
  110454. "R": "input"
  110455. },
  110456. "connections": {
  110457. "C": [ 42 ],
  110458. "D": [ 1203 ],
  110459. "E": [ 1040 ],
  110460. "Q": [ 4868 ],
  110461. "R": [ 127 ]
  110462. }
  110463. },
  110464. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  110465. "hide_name": 0,
  110466. "type": "SB_LUT4",
  110467. "parameters": {
  110468. "LUT_INIT": "0011111100000000"
  110469. },
  110470. "attributes": {
  110471. "module_not_derived": "00000000000000000000000000000001",
  110472. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110473. },
  110474. "port_directions": {
  110475. "I0": "input",
  110476. "I1": "input",
  110477. "I2": "input",
  110478. "I3": "input",
  110479. "O": "output"
  110480. },
  110481. "connections": {
  110482. "I0": [ "0" ],
  110483. "I1": [ 4256 ],
  110484. "I2": [ 2868 ],
  110485. "I3": [ 4869 ],
  110486. "O": [ 4864 ]
  110487. }
  110488. },
  110489. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  110490. "hide_name": 0,
  110491. "type": "SB_LUT4",
  110492. "parameters": {
  110493. "LUT_INIT": "1111010101010011"
  110494. },
  110495. "attributes": {
  110496. "module_not_derived": "00000000000000000000000000000001",
  110497. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110498. },
  110499. "port_directions": {
  110500. "I0": "input",
  110501. "I1": "input",
  110502. "I2": "input",
  110503. "I3": "input",
  110504. "O": "output"
  110505. },
  110506. "connections": {
  110507. "I0": [ 943 ],
  110508. "I1": [ 3657 ],
  110509. "I2": [ 2871 ],
  110510. "I3": [ 2872 ],
  110511. "O": [ 4869 ]
  110512. }
  110513. },
  110514. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  110515. "hide_name": 0,
  110516. "type": "SB_CARRY",
  110517. "parameters": {
  110518. },
  110519. "attributes": {
  110520. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  110521. },
  110522. "port_directions": {
  110523. "CI": "input",
  110524. "CO": "output",
  110525. "I0": "input",
  110526. "I1": "input"
  110527. },
  110528. "connections": {
  110529. "CI": [ 4861 ],
  110530. "CO": [ 4863 ],
  110531. "I0": [ 2522 ],
  110532. "I1": [ 4860 ]
  110533. }
  110534. },
  110535. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_5": {
  110536. "hide_name": 0,
  110537. "type": "SB_LUT4",
  110538. "parameters": {
  110539. "LUT_INIT": "1100100110011100"
  110540. },
  110541. "attributes": {
  110542. "module_not_derived": "00000000000000000000000000000001",
  110543. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110544. },
  110545. "port_directions": {
  110546. "I0": "input",
  110547. "I1": "input",
  110548. "I2": "input",
  110549. "I3": "input",
  110550. "O": "output"
  110551. },
  110552. "connections": {
  110553. "I0": [ 1254 ],
  110554. "I1": [ 2526 ],
  110555. "I2": [ 4870 ],
  110556. "I3": [ 4871 ],
  110557. "O": [ 2892 ]
  110558. }
  110559. },
  110560. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_5_I2_SB_LUT4_O": {
  110561. "hide_name": 0,
  110562. "type": "SB_LUT4",
  110563. "parameters": {
  110564. "LUT_INIT": "1111000000001111"
  110565. },
  110566. "attributes": {
  110567. "module_not_derived": "00000000000000000000000000000001",
  110568. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110569. },
  110570. "port_directions": {
  110571. "I0": "input",
  110572. "I1": "input",
  110573. "I2": "input",
  110574. "I3": "input",
  110575. "O": "output"
  110576. },
  110577. "connections": {
  110578. "I0": [ "0" ],
  110579. "I1": [ "0" ],
  110580. "I2": [ 2991 ],
  110581. "I3": [ 2893 ],
  110582. "O": [ 4870 ]
  110583. }
  110584. },
  110585. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  110586. "hide_name": 0,
  110587. "type": "SB_CARRY",
  110588. "parameters": {
  110589. },
  110590. "attributes": {
  110591. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  110592. },
  110593. "port_directions": {
  110594. "CI": "input",
  110595. "CO": "output",
  110596. "I0": "input",
  110597. "I1": "input"
  110598. },
  110599. "connections": {
  110600. "CI": [ 4863 ],
  110601. "CO": [ 4871 ],
  110602. "I0": [ 2524 ],
  110603. "I1": [ 4862 ]
  110604. }
  110605. },
  110606. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6": {
  110607. "hide_name": 0,
  110608. "type": "SB_LUT4",
  110609. "parameters": {
  110610. "LUT_INIT": "1100100110011100"
  110611. },
  110612. "attributes": {
  110613. "module_not_derived": "00000000000000000000000000000001",
  110614. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110615. },
  110616. "port_directions": {
  110617. "I0": "input",
  110618. "I1": "input",
  110619. "I2": "input",
  110620. "I3": "input",
  110621. "O": "output"
  110622. },
  110623. "connections": {
  110624. "I0": [ 1254 ],
  110625. "I1": [ 2528 ],
  110626. "I2": [ 4872 ],
  110627. "I3": [ 4873 ],
  110628. "O": [ 3693 ]
  110629. }
  110630. },
  110631. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O": {
  110632. "hide_name": 0,
  110633. "type": "SB_LUT4",
  110634. "parameters": {
  110635. "LUT_INIT": "1111000000001111"
  110636. },
  110637. "attributes": {
  110638. "module_not_derived": "00000000000000000000000000000001",
  110639. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110640. },
  110641. "port_directions": {
  110642. "I0": "input",
  110643. "I1": "input",
  110644. "I2": "input",
  110645. "I3": "input",
  110646. "O": "output"
  110647. },
  110648. "connections": {
  110649. "I0": [ "0" ],
  110650. "I1": [ "0" ],
  110651. "I2": [ 2991 ],
  110652. "I3": [ 4874 ],
  110653. "O": [ 4872 ]
  110654. }
  110655. },
  110656. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  110657. "hide_name": 0,
  110658. "type": "SB_LUT4",
  110659. "parameters": {
  110660. "LUT_INIT": "1111000000001111"
  110661. },
  110662. "attributes": {
  110663. "module_not_derived": "00000000000000000000000000000001",
  110664. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110665. },
  110666. "port_directions": {
  110667. "I0": "input",
  110668. "I1": "input",
  110669. "I2": "input",
  110670. "I3": "input",
  110671. "O": "output"
  110672. },
  110673. "connections": {
  110674. "I0": [ "0" ],
  110675. "I1": [ "0" ],
  110676. "I2": [ 2528 ],
  110677. "I3": [ 4874 ],
  110678. "O": [ 4875 ]
  110679. }
  110680. },
  110681. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1": {
  110682. "hide_name": 0,
  110683. "type": "SB_LUT4",
  110684. "parameters": {
  110685. "LUT_INIT": "0010111110010010"
  110686. },
  110687. "attributes": {
  110688. "module_not_derived": "00000000000000000000000000000001",
  110689. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110690. },
  110691. "port_directions": {
  110692. "I0": "input",
  110693. "I1": "input",
  110694. "I2": "input",
  110695. "I3": "input",
  110696. "O": "output"
  110697. },
  110698. "connections": {
  110699. "I0": [ 966 ],
  110700. "I1": [ 1250 ],
  110701. "I2": [ 2528 ],
  110702. "I3": [ 4874 ],
  110703. "O": [ 4876 ]
  110704. }
  110705. },
  110706. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2": {
  110707. "hide_name": 0,
  110708. "type": "SB_LUT4",
  110709. "parameters": {
  110710. "LUT_INIT": "0110010011111101"
  110711. },
  110712. "attributes": {
  110713. "module_not_derived": "00000000000000000000000000000001",
  110714. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110715. },
  110716. "port_directions": {
  110717. "I0": "input",
  110718. "I1": "input",
  110719. "I2": "input",
  110720. "I3": "input",
  110721. "O": "output"
  110722. },
  110723. "connections": {
  110724. "I0": [ 1246 ],
  110725. "I1": [ 1247 ],
  110726. "I2": [ 4876 ],
  110727. "I3": [ 3693 ],
  110728. "O": [ 2900 ]
  110729. }
  110730. },
  110731. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O": {
  110732. "hide_name": 0,
  110733. "type": "SB_LUT4",
  110734. "parameters": {
  110735. "LUT_INIT": "0011111100000000"
  110736. },
  110737. "attributes": {
  110738. "module_not_derived": "00000000000000000000000000000001",
  110739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110740. },
  110741. "port_directions": {
  110742. "I0": "input",
  110743. "I1": "input",
  110744. "I2": "input",
  110745. "I3": "input",
  110746. "O": "output"
  110747. },
  110748. "connections": {
  110749. "I0": [ "0" ],
  110750. "I1": [ 1162 ],
  110751. "I2": [ 1034 ],
  110752. "I3": [ 4877 ],
  110753. "O": [ 2899 ]
  110754. }
  110755. },
  110756. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  110757. "hide_name": 0,
  110758. "type": "SB_LUT4",
  110759. "parameters": {
  110760. "LUT_INIT": "0001001101011111"
  110761. },
  110762. "attributes": {
  110763. "module_not_derived": "00000000000000000000000000000001",
  110764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110765. },
  110766. "port_directions": {
  110767. "I0": "input",
  110768. "I1": "input",
  110769. "I2": "input",
  110770. "I3": "input",
  110771. "O": "output"
  110772. },
  110773. "connections": {
  110774. "I0": [ 1080 ],
  110775. "I1": [ 1037 ],
  110776. "I2": [ 1043 ],
  110777. "I3": [ 4878 ],
  110778. "O": [ 4877 ]
  110779. }
  110780. },
  110781. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  110782. "hide_name": 0,
  110783. "type": "SB_DFFER",
  110784. "parameters": {
  110785. },
  110786. "attributes": {
  110787. "module_not_derived": "00000000000000000000000000000001",
  110788. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  110789. },
  110790. "port_directions": {
  110791. "C": "input",
  110792. "D": "input",
  110793. "E": "input",
  110794. "Q": "output",
  110795. "R": "input"
  110796. },
  110797. "connections": {
  110798. "C": [ 42 ],
  110799. "D": [ 1199 ],
  110800. "E": [ 1040 ],
  110801. "Q": [ 4878 ],
  110802. "R": [ 127 ]
  110803. }
  110804. },
  110805. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  110806. "hide_name": 0,
  110807. "type": "SB_LUT4",
  110808. "parameters": {
  110809. "LUT_INIT": "0011111100000000"
  110810. },
  110811. "attributes": {
  110812. "module_not_derived": "00000000000000000000000000000001",
  110813. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  110814. },
  110815. "port_directions": {
  110816. "I0": "input",
  110817. "I1": "input",
  110818. "I2": "input",
  110819. "I3": "input",
  110820. "O": "output"
  110821. },
  110822. "connections": {
  110823. "I0": [ "0" ],
  110824. "I1": [ 4255 ],
  110825. "I2": [ 2868 ],
  110826. "I3": [ 4879 ],
  110827. "O": [ 4874 ]
  110828. }
  110829. },
  110830. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  110831. "hide_name": 0,
  110832. "type": "SB_LUT4",
  110833. "parameters": {
  110834. "LUT_INIT": "1111010101010011"
  110835. },
  110836. "attributes": {
  110837. "module_not_derived": "00000000000000000000000000000001",
  110838. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110839. },
  110840. "port_directions": {
  110841. "I0": "input",
  110842. "I1": "input",
  110843. "I2": "input",
  110844. "I3": "input",
  110845. "O": "output"
  110846. },
  110847. "connections": {
  110848. "I0": [ 943 ],
  110849. "I1": [ 3664 ],
  110850. "I2": [ 2871 ],
  110851. "I3": [ 2872 ],
  110852. "O": [ 4879 ]
  110853. }
  110854. },
  110855. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  110856. "hide_name": 0,
  110857. "type": "SB_CARRY",
  110858. "parameters": {
  110859. },
  110860. "attributes": {
  110861. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  110862. },
  110863. "port_directions": {
  110864. "CI": "input",
  110865. "CO": "output",
  110866. "I0": "input",
  110867. "I1": "input"
  110868. },
  110869. "connections": {
  110870. "CI": [ 4871 ],
  110871. "CO": [ 4873 ],
  110872. "I0": [ 2526 ],
  110873. "I1": [ 4870 ]
  110874. }
  110875. },
  110876. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7": {
  110877. "hide_name": 0,
  110878. "type": "SB_LUT4",
  110879. "parameters": {
  110880. "LUT_INIT": "1100100110011100"
  110881. },
  110882. "attributes": {
  110883. "module_not_derived": "00000000000000000000000000000001",
  110884. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110885. },
  110886. "port_directions": {
  110887. "I0": "input",
  110888. "I1": "input",
  110889. "I2": "input",
  110890. "I3": "input",
  110891. "O": "output"
  110892. },
  110893. "connections": {
  110894. "I0": [ 1254 ],
  110895. "I1": [ 2527 ],
  110896. "I2": [ 4880 ],
  110897. "I3": [ 4881 ],
  110898. "O": [ 2908 ]
  110899. }
  110900. },
  110901. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I1_SB_LUT4_O": {
  110902. "hide_name": 0,
  110903. "type": "SB_LUT4",
  110904. "parameters": {
  110905. "LUT_INIT": "0000110000001010"
  110906. },
  110907. "attributes": {
  110908. "module_not_derived": "00000000000000000000000000000001",
  110909. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110910. },
  110911. "port_directions": {
  110912. "I0": "input",
  110913. "I1": "input",
  110914. "I2": "input",
  110915. "I3": "input",
  110916. "O": "output"
  110917. },
  110918. "connections": {
  110919. "I0": [ 4074 ],
  110920. "I1": [ 960 ],
  110921. "I2": [ 2757 ],
  110922. "I3": [ 2758 ],
  110923. "O": [ 2528 ]
  110924. }
  110925. },
  110926. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I1_SB_LUT4_O_1": {
  110927. "hide_name": 0,
  110928. "type": "SB_LUT4",
  110929. "parameters": {
  110930. "LUT_INIT": "0000110000001010"
  110931. },
  110932. "attributes": {
  110933. "module_not_derived": "00000000000000000000000000000001",
  110934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  110935. },
  110936. "port_directions": {
  110937. "I0": "input",
  110938. "I1": "input",
  110939. "I2": "input",
  110940. "I3": "input",
  110941. "O": "output"
  110942. },
  110943. "connections": {
  110944. "I0": [ 4069 ],
  110945. "I1": [ 958 ],
  110946. "I2": [ 2757 ],
  110947. "I3": [ 2758 ],
  110948. "O": [ 2527 ]
  110949. }
  110950. },
  110951. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I2_SB_LUT4_O": {
  110952. "hide_name": 0,
  110953. "type": "SB_LUT4",
  110954. "parameters": {
  110955. "LUT_INIT": "1111000000001111"
  110956. },
  110957. "attributes": {
  110958. "module_not_derived": "00000000000000000000000000000001",
  110959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  110960. },
  110961. "port_directions": {
  110962. "I0": "input",
  110963. "I1": "input",
  110964. "I2": "input",
  110965. "I3": "input",
  110966. "O": "output"
  110967. },
  110968. "connections": {
  110969. "I0": [ "0" ],
  110970. "I1": [ "0" ],
  110971. "I2": [ 2991 ],
  110972. "I3": [ 2909 ],
  110973. "O": [ 4880 ]
  110974. }
  110975. },
  110976. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  110977. "hide_name": 0,
  110978. "type": "SB_CARRY",
  110979. "parameters": {
  110980. },
  110981. "attributes": {
  110982. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  110983. },
  110984. "port_directions": {
  110985. "CI": "input",
  110986. "CO": "output",
  110987. "I0": "input",
  110988. "I1": "input"
  110989. },
  110990. "connections": {
  110991. "CI": [ 4873 ],
  110992. "CO": [ 4881 ],
  110993. "I0": [ 2528 ],
  110994. "I1": [ 4872 ]
  110995. }
  110996. },
  110997. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8": {
  110998. "hide_name": 0,
  110999. "type": "SB_LUT4",
  111000. "parameters": {
  111001. "LUT_INIT": "1100100110011100"
  111002. },
  111003. "attributes": {
  111004. "module_not_derived": "00000000000000000000000000000001",
  111005. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111006. },
  111007. "port_directions": {
  111008. "I0": "input",
  111009. "I1": "input",
  111010. "I2": "input",
  111011. "I3": "input",
  111012. "O": "output"
  111013. },
  111014. "connections": {
  111015. "I0": [ 1254 ],
  111016. "I1": [ 2525 ],
  111017. "I2": [ 4882 ],
  111018. "I3": [ 4883 ],
  111019. "O": [ 3692 ]
  111020. }
  111021. },
  111022. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I1_SB_LUT4_O": {
  111023. "hide_name": 0,
  111024. "type": "SB_LUT4",
  111025. "parameters": {
  111026. "LUT_INIT": "0000101000001100"
  111027. },
  111028. "attributes": {
  111029. "module_not_derived": "00000000000000000000000000000001",
  111030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111031. },
  111032. "port_directions": {
  111033. "I0": "input",
  111034. "I1": "input",
  111035. "I2": "input",
  111036. "I3": "input",
  111037. "O": "output"
  111038. },
  111039. "connections": {
  111040. "I0": [ 962 ],
  111041. "I1": [ 4079 ],
  111042. "I2": [ 2757 ],
  111043. "I3": [ 2758 ],
  111044. "O": [ 2526 ]
  111045. }
  111046. },
  111047. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I1_SB_LUT4_O_1": {
  111048. "hide_name": 0,
  111049. "type": "SB_LUT4",
  111050. "parameters": {
  111051. "LUT_INIT": "0000110000001010"
  111052. },
  111053. "attributes": {
  111054. "module_not_derived": "00000000000000000000000000000001",
  111055. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111056. },
  111057. "port_directions": {
  111058. "I0": "input",
  111059. "I1": "input",
  111060. "I2": "input",
  111061. "I3": "input",
  111062. "O": "output"
  111063. },
  111064. "connections": {
  111065. "I0": [ 4064 ],
  111066. "I1": [ 956 ],
  111067. "I2": [ 2757 ],
  111068. "I3": [ 2758 ],
  111069. "O": [ 2525 ]
  111070. }
  111071. },
  111072. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O": {
  111073. "hide_name": 0,
  111074. "type": "SB_LUT4",
  111075. "parameters": {
  111076. "LUT_INIT": "1111000000001111"
  111077. },
  111078. "attributes": {
  111079. "module_not_derived": "00000000000000000000000000000001",
  111080. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  111081. },
  111082. "port_directions": {
  111083. "I0": "input",
  111084. "I1": "input",
  111085. "I2": "input",
  111086. "I3": "input",
  111087. "O": "output"
  111088. },
  111089. "connections": {
  111090. "I0": [ "0" ],
  111091. "I1": [ "0" ],
  111092. "I2": [ 2991 ],
  111093. "I3": [ 4884 ],
  111094. "O": [ 4882 ]
  111095. }
  111096. },
  111097. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I1": {
  111098. "hide_name": 0,
  111099. "type": "SB_LUT4",
  111100. "parameters": {
  111101. "LUT_INIT": "0000011000000000"
  111102. },
  111103. "attributes": {
  111104. "module_not_derived": "00000000000000000000000000000001",
  111105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111106. },
  111107. "port_directions": {
  111108. "I0": "input",
  111109. "I1": "input",
  111110. "I2": "input",
  111111. "I3": "input",
  111112. "O": "output"
  111113. },
  111114. "connections": {
  111115. "I0": [ 2525 ],
  111116. "I1": [ 4884 ],
  111117. "I2": [ 4865 ],
  111118. "I3": [ 2895 ],
  111119. "O": [ 4296 ]
  111120. }
  111121. },
  111122. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I1_O_SB_LUT4_O": {
  111123. "hide_name": 0,
  111124. "type": "SB_LUT4",
  111125. "parameters": {
  111126. "LUT_INIT": "0000000000000001"
  111127. },
  111128. "attributes": {
  111129. "module_not_derived": "00000000000000000000000000000001",
  111130. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111131. },
  111132. "port_directions": {
  111133. "I0": "input",
  111134. "I1": "input",
  111135. "I2": "input",
  111136. "I3": "input",
  111137. "O": "output"
  111138. },
  111139. "connections": {
  111140. "I0": [ 2879 ],
  111141. "I1": [ 4875 ],
  111142. "I2": [ 4796 ],
  111143. "I3": [ 4778 ],
  111144. "O": [ 4297 ]
  111145. }
  111146. },
  111147. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I1_O_SB_LUT4_O_1": {
  111148. "hide_name": 0,
  111149. "type": "SB_LUT4",
  111150. "parameters": {
  111151. "LUT_INIT": "0000011000000000"
  111152. },
  111153. "attributes": {
  111154. "module_not_derived": "00000000000000000000000000000001",
  111155. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111156. },
  111157. "port_directions": {
  111158. "I0": "input",
  111159. "I1": "input",
  111160. "I2": "input",
  111161. "I3": "input",
  111162. "O": "output"
  111163. },
  111164. "connections": {
  111165. "I0": [ 2474 ],
  111166. "I1": [ 2362 ],
  111167. "I2": [ 2931 ],
  111168. "I3": [ 4818 ],
  111169. "O": [ 4294 ]
  111170. }
  111171. },
  111172. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I1_O_SB_LUT4_O_2": {
  111173. "hide_name": 0,
  111174. "type": "SB_LUT4",
  111175. "parameters": {
  111176. "LUT_INIT": "0000011000000000"
  111177. },
  111178. "attributes": {
  111179. "module_not_derived": "00000000000000000000000000000001",
  111180. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111181. },
  111182. "port_directions": {
  111183. "I0": "input",
  111184. "I1": "input",
  111185. "I2": "input",
  111186. "I3": "input",
  111187. "O": "output"
  111188. },
  111189. "connections": {
  111190. "I0": [ 2470 ],
  111191. "I1": [ 2367 ],
  111192. "I2": [ 4281 ],
  111193. "I3": [ 3056 ],
  111194. "O": [ 4295 ]
  111195. }
  111196. },
  111197. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  111198. "hide_name": 0,
  111199. "type": "SB_LUT4",
  111200. "parameters": {
  111201. "LUT_INIT": "0010111110010010"
  111202. },
  111203. "attributes": {
  111204. "module_not_derived": "00000000000000000000000000000001",
  111205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111206. },
  111207. "port_directions": {
  111208. "I0": "input",
  111209. "I1": "input",
  111210. "I2": "input",
  111211. "I3": "input",
  111212. "O": "output"
  111213. },
  111214. "connections": {
  111215. "I0": [ 966 ],
  111216. "I1": [ 1250 ],
  111217. "I2": [ 2525 ],
  111218. "I3": [ 4884 ],
  111219. "O": [ 4885 ]
  111220. }
  111221. },
  111222. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2": {
  111223. "hide_name": 0,
  111224. "type": "SB_LUT4",
  111225. "parameters": {
  111226. "LUT_INIT": "0110010011111101"
  111227. },
  111228. "attributes": {
  111229. "module_not_derived": "00000000000000000000000000000001",
  111230. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111231. },
  111232. "port_directions": {
  111233. "I0": "input",
  111234. "I1": "input",
  111235. "I2": "input",
  111236. "I3": "input",
  111237. "O": "output"
  111238. },
  111239. "connections": {
  111240. "I0": [ 1246 ],
  111241. "I1": [ 1247 ],
  111242. "I2": [ 4885 ],
  111243. "I3": [ 3692 ],
  111244. "O": [ 2915 ]
  111245. }
  111246. },
  111247. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  111248. "hide_name": 0,
  111249. "type": "SB_LUT4",
  111250. "parameters": {
  111251. "LUT_INIT": "0011111100000000"
  111252. },
  111253. "attributes": {
  111254. "module_not_derived": "00000000000000000000000000000001",
  111255. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  111256. },
  111257. "port_directions": {
  111258. "I0": "input",
  111259. "I1": "input",
  111260. "I2": "input",
  111261. "I3": "input",
  111262. "O": "output"
  111263. },
  111264. "connections": {
  111265. "I0": [ "0" ],
  111266. "I1": [ 1160 ],
  111267. "I2": [ 1034 ],
  111268. "I3": [ 4886 ],
  111269. "O": [ 2914 ]
  111270. }
  111271. },
  111272. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  111273. "hide_name": 0,
  111274. "type": "SB_LUT4",
  111275. "parameters": {
  111276. "LUT_INIT": "0001001101011111"
  111277. },
  111278. "attributes": {
  111279. "module_not_derived": "00000000000000000000000000000001",
  111280. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111281. },
  111282. "port_directions": {
  111283. "I0": "input",
  111284. "I1": "input",
  111285. "I2": "input",
  111286. "I3": "input",
  111287. "O": "output"
  111288. },
  111289. "connections": {
  111290. "I0": [ 1076 ],
  111291. "I1": [ 1037 ],
  111292. "I2": [ 1043 ],
  111293. "I3": [ 4887 ],
  111294. "O": [ 4886 ]
  111295. }
  111296. },
  111297. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  111298. "hide_name": 0,
  111299. "type": "SB_DFFER",
  111300. "parameters": {
  111301. },
  111302. "attributes": {
  111303. "module_not_derived": "00000000000000000000000000000001",
  111304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  111305. },
  111306. "port_directions": {
  111307. "C": "input",
  111308. "D": "input",
  111309. "E": "input",
  111310. "Q": "output",
  111311. "R": "input"
  111312. },
  111313. "connections": {
  111314. "C": [ 42 ],
  111315. "D": [ 1195 ],
  111316. "E": [ 1040 ],
  111317. "Q": [ 4887 ],
  111318. "R": [ 127 ]
  111319. }
  111320. },
  111321. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  111322. "hide_name": 0,
  111323. "type": "SB_LUT4",
  111324. "parameters": {
  111325. "LUT_INIT": "0011111100000000"
  111326. },
  111327. "attributes": {
  111328. "module_not_derived": "00000000000000000000000000000001",
  111329. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  111330. },
  111331. "port_directions": {
  111332. "I0": "input",
  111333. "I1": "input",
  111334. "I2": "input",
  111335. "I3": "input",
  111336. "O": "output"
  111337. },
  111338. "connections": {
  111339. "I0": [ "0" ],
  111340. "I1": [ 4254 ],
  111341. "I2": [ 2868 ],
  111342. "I3": [ 4888 ],
  111343. "O": [ 4884 ]
  111344. }
  111345. },
  111346. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  111347. "hide_name": 0,
  111348. "type": "SB_LUT4",
  111349. "parameters": {
  111350. "LUT_INIT": "1111010101010011"
  111351. },
  111352. "attributes": {
  111353. "module_not_derived": "00000000000000000000000000000001",
  111354. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111355. },
  111356. "port_directions": {
  111357. "I0": "input",
  111358. "I1": "input",
  111359. "I2": "input",
  111360. "I3": "input",
  111361. "O": "output"
  111362. },
  111363. "connections": {
  111364. "I0": [ 943 ],
  111365. "I1": [ 3676 ],
  111366. "I2": [ 2871 ],
  111367. "I3": [ 2872 ],
  111368. "O": [ 4888 ]
  111369. }
  111370. },
  111371. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  111372. "hide_name": 0,
  111373. "type": "SB_CARRY",
  111374. "parameters": {
  111375. },
  111376. "attributes": {
  111377. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  111378. },
  111379. "port_directions": {
  111380. "CI": "input",
  111381. "CO": "output",
  111382. "I0": "input",
  111383. "I1": "input"
  111384. },
  111385. "connections": {
  111386. "CI": [ 4881 ],
  111387. "CO": [ 4883 ],
  111388. "I0": [ 2527 ],
  111389. "I1": [ 4880 ]
  111390. }
  111391. },
  111392. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9": {
  111393. "hide_name": 0,
  111394. "type": "SB_LUT4",
  111395. "parameters": {
  111396. "LUT_INIT": "1100100110011100"
  111397. },
  111398. "attributes": {
  111399. "module_not_derived": "00000000000000000000000000000001",
  111400. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111401. },
  111402. "port_directions": {
  111403. "I0": "input",
  111404. "I1": "input",
  111405. "I2": "input",
  111406. "I3": "input",
  111407. "O": "output"
  111408. },
  111409. "connections": {
  111410. "I0": [ 1254 ],
  111411. "I1": [ 2523 ],
  111412. "I2": [ 4772 ],
  111413. "I3": [ 4771 ],
  111414. "O": [ 3691 ]
  111415. }
  111416. },
  111417. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I1_SB_LUT4_O": {
  111418. "hide_name": 0,
  111419. "type": "SB_LUT4",
  111420. "parameters": {
  111421. "LUT_INIT": "0000101000001100"
  111422. },
  111423. "attributes": {
  111424. "module_not_derived": "00000000000000000000000000000001",
  111425. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111426. },
  111427. "port_directions": {
  111428. "I0": "input",
  111429. "I1": "input",
  111430. "I2": "input",
  111431. "I3": "input",
  111432. "O": "output"
  111433. },
  111434. "connections": {
  111435. "I0": [ 964 ],
  111436. "I1": [ 4084 ],
  111437. "I2": [ 2757 ],
  111438. "I3": [ 2758 ],
  111439. "O": [ 2524 ]
  111440. }
  111441. },
  111442. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I1_SB_LUT4_O_1": {
  111443. "hide_name": 0,
  111444. "type": "SB_LUT4",
  111445. "parameters": {
  111446. "LUT_INIT": "0000110000001010"
  111447. },
  111448. "attributes": {
  111449. "module_not_derived": "00000000000000000000000000000001",
  111450. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111451. },
  111452. "port_directions": {
  111453. "I0": "input",
  111454. "I1": "input",
  111455. "I2": "input",
  111456. "I3": "input",
  111457. "O": "output"
  111458. },
  111459. "connections": {
  111460. "I0": [ 4059 ],
  111461. "I1": [ 954 ],
  111462. "I2": [ 2757 ],
  111463. "I3": [ 2758 ],
  111464. "O": [ 2523 ]
  111465. }
  111466. },
  111467. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O": {
  111468. "hide_name": 0,
  111469. "type": "SB_LUT4",
  111470. "parameters": {
  111471. "LUT_INIT": "1111000000001111"
  111472. },
  111473. "attributes": {
  111474. "module_not_derived": "00000000000000000000000000000001",
  111475. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  111476. },
  111477. "port_directions": {
  111478. "I0": "input",
  111479. "I1": "input",
  111480. "I2": "input",
  111481. "I3": "input",
  111482. "O": "output"
  111483. },
  111484. "connections": {
  111485. "I0": [ "0" ],
  111486. "I1": [ "0" ],
  111487. "I2": [ 2991 ],
  111488. "I3": [ 2894 ],
  111489. "O": [ 4772 ]
  111490. }
  111491. },
  111492. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3": {
  111493. "hide_name": 0,
  111494. "type": "SB_LUT4",
  111495. "parameters": {
  111496. "LUT_INIT": "0010111110010010"
  111497. },
  111498. "attributes": {
  111499. "module_not_derived": "00000000000000000000000000000001",
  111500. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111501. },
  111502. "port_directions": {
  111503. "I0": "input",
  111504. "I1": "input",
  111505. "I2": "input",
  111506. "I3": "input",
  111507. "O": "output"
  111508. },
  111509. "connections": {
  111510. "I0": [ 966 ],
  111511. "I1": [ 1250 ],
  111512. "I2": [ 2523 ],
  111513. "I3": [ 2894 ],
  111514. "O": [ 4889 ]
  111515. }
  111516. },
  111517. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2": {
  111518. "hide_name": 0,
  111519. "type": "SB_LUT4",
  111520. "parameters": {
  111521. "LUT_INIT": "0110010011111101"
  111522. },
  111523. "attributes": {
  111524. "module_not_derived": "00000000000000000000000000000001",
  111525. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111526. },
  111527. "port_directions": {
  111528. "I0": "input",
  111529. "I1": "input",
  111530. "I2": "input",
  111531. "I3": "input",
  111532. "O": "output"
  111533. },
  111534. "connections": {
  111535. "I0": [ 1246 ],
  111536. "I1": [ 1247 ],
  111537. "I2": [ 4889 ],
  111538. "I3": [ 3691 ],
  111539. "O": [ 2918 ]
  111540. }
  111541. },
  111542. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  111543. "hide_name": 0,
  111544. "type": "SB_LUT4",
  111545. "parameters": {
  111546. "LUT_INIT": "0011111100000000"
  111547. },
  111548. "attributes": {
  111549. "module_not_derived": "00000000000000000000000000000001",
  111550. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  111551. },
  111552. "port_directions": {
  111553. "I0": "input",
  111554. "I1": "input",
  111555. "I2": "input",
  111556. "I3": "input",
  111557. "O": "output"
  111558. },
  111559. "connections": {
  111560. "I0": [ "0" ],
  111561. "I1": [ 1159 ],
  111562. "I2": [ 1034 ],
  111563. "I3": [ 4890 ],
  111564. "O": [ 2917 ]
  111565. }
  111566. },
  111567. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  111568. "hide_name": 0,
  111569. "type": "SB_LUT4",
  111570. "parameters": {
  111571. "LUT_INIT": "0001001101011111"
  111572. },
  111573. "attributes": {
  111574. "module_not_derived": "00000000000000000000000000000001",
  111575. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111576. },
  111577. "port_directions": {
  111578. "I0": "input",
  111579. "I1": "input",
  111580. "I2": "input",
  111581. "I3": "input",
  111582. "O": "output"
  111583. },
  111584. "connections": {
  111585. "I0": [ 1074 ],
  111586. "I1": [ 1037 ],
  111587. "I2": [ 1043 ],
  111588. "I3": [ 4891 ],
  111589. "O": [ 4890 ]
  111590. }
  111591. },
  111592. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_DFFER_Q": {
  111593. "hide_name": 0,
  111594. "type": "SB_DFFER",
  111595. "parameters": {
  111596. },
  111597. "attributes": {
  111598. "module_not_derived": "00000000000000000000000000000001",
  111599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  111600. },
  111601. "port_directions": {
  111602. "C": "input",
  111603. "D": "input",
  111604. "E": "input",
  111605. "Q": "output",
  111606. "R": "input"
  111607. },
  111608. "connections": {
  111609. "C": [ 42 ],
  111610. "D": [ 1193 ],
  111611. "E": [ 1040 ],
  111612. "Q": [ 4891 ],
  111613. "R": [ 127 ]
  111614. }
  111615. },
  111616. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O": {
  111617. "hide_name": 0,
  111618. "type": "SB_LUT4",
  111619. "parameters": {
  111620. "LUT_INIT": "0011111100000000"
  111621. },
  111622. "attributes": {
  111623. "module_not_derived": "00000000000000000000000000000001",
  111624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  111625. },
  111626. "port_directions": {
  111627. "I0": "input",
  111628. "I1": "input",
  111629. "I2": "input",
  111630. "I3": "input",
  111631. "O": "output"
  111632. },
  111633. "connections": {
  111634. "I0": [ "0" ],
  111635. "I1": [ 4253 ],
  111636. "I2": [ 2868 ],
  111637. "I3": [ 4892 ],
  111638. "O": [ 2894 ]
  111639. }
  111640. },
  111641. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  111642. "hide_name": 0,
  111643. "type": "SB_LUT4",
  111644. "parameters": {
  111645. "LUT_INIT": "1111010101010011"
  111646. },
  111647. "attributes": {
  111648. "module_not_derived": "00000000000000000000000000000001",
  111649. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111650. },
  111651. "port_directions": {
  111652. "I0": "input",
  111653. "I1": "input",
  111654. "I2": "input",
  111655. "I3": "input",
  111656. "O": "output"
  111657. },
  111658. "connections": {
  111659. "I0": [ 943 ],
  111660. "I1": [ 3674 ],
  111661. "I2": [ 2871 ],
  111662. "I3": [ 2872 ],
  111663. "O": [ 4892 ]
  111664. }
  111665. },
  111666. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  111667. "hide_name": 0,
  111668. "type": "SB_CARRY",
  111669. "parameters": {
  111670. },
  111671. "attributes": {
  111672. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  111673. },
  111674. "port_directions": {
  111675. "CI": "input",
  111676. "CO": "output",
  111677. "I0": "input",
  111678. "I1": "input"
  111679. },
  111680. "connections": {
  111681. "CI": [ 4883 ],
  111682. "CO": [ 4771 ],
  111683. "I0": [ 2525 ],
  111684. "I1": [ 4882 ]
  111685. }
  111686. },
  111687. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_I1_SB_LUT4_O": {
  111688. "hide_name": 0,
  111689. "type": "SB_LUT4",
  111690. "parameters": {
  111691. "LUT_INIT": "0000101000001100"
  111692. },
  111693. "attributes": {
  111694. "module_not_derived": "00000000000000000000000000000001",
  111695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111696. },
  111697. "port_directions": {
  111698. "I0": "input",
  111699. "I1": "input",
  111700. "I2": "input",
  111701. "I3": "input",
  111702. "O": "output"
  111703. },
  111704. "connections": {
  111705. "I0": [ 1006 ],
  111706. "I1": [ 4033 ],
  111707. "I2": [ 2757 ],
  111708. "I3": [ 2758 ],
  111709. "O": [ 2394 ]
  111710. }
  111711. },
  111712. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_I1_SB_LUT4_O_1": {
  111713. "hide_name": 0,
  111714. "type": "SB_LUT4",
  111715. "parameters": {
  111716. "LUT_INIT": "1111000000000000"
  111717. },
  111718. "attributes": {
  111719. "module_not_derived": "00000000000000000000000000000001",
  111720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  111721. },
  111722. "port_directions": {
  111723. "I0": "input",
  111724. "I1": "input",
  111725. "I2": "input",
  111726. "I3": "input",
  111727. "O": "output"
  111728. },
  111729. "connections": {
  111730. "I0": [ "0" ],
  111731. "I1": [ "0" ],
  111732. "I2": [ 4047 ],
  111733. "I3": [ 2847 ],
  111734. "O": [ 2395 ]
  111735. }
  111736. },
  111737. "cpu_I.execute_arbitration_isStuckByOthers_SB_LUT4_O": {
  111738. "hide_name": 0,
  111739. "type": "SB_LUT4",
  111740. "parameters": {
  111741. "LUT_INIT": "1111111111110000"
  111742. },
  111743. "attributes": {
  111744. "module_not_derived": "00000000000000000000000000000001",
  111745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  111746. },
  111747. "port_directions": {
  111748. "I0": "input",
  111749. "I1": "input",
  111750. "I2": "input",
  111751. "I3": "input",
  111752. "O": "output"
  111753. },
  111754. "connections": {
  111755. "I0": [ "0" ],
  111756. "I1": [ "0" ],
  111757. "I2": [ 4134 ],
  111758. "I3": [ 4135 ],
  111759. "O": [ 1018 ]
  111760. }
  111761. },
  111762. "cpu_I.execute_arbitration_isStuck_SB_LUT4_O": {
  111763. "hide_name": 0,
  111764. "type": "SB_LUT4",
  111765. "parameters": {
  111766. "LUT_INIT": "1110000011111111"
  111767. },
  111768. "attributes": {
  111769. "module_not_derived": "00000000000000000000000000000001",
  111770. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  111771. },
  111772. "port_directions": {
  111773. "I0": "input",
  111774. "I1": "input",
  111775. "I2": "input",
  111776. "I3": "input",
  111777. "O": "output"
  111778. },
  111779. "connections": {
  111780. "I0": [ 2326 ],
  111781. "I1": [ 3090 ],
  111782. "I2": [ 2858 ],
  111783. "I3": [ 3982 ],
  111784. "O": [ 1020 ]
  111785. }
  111786. },
  111787. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q": {
  111788. "hide_name": 0,
  111789. "type": "SB_DFFE",
  111790. "parameters": {
  111791. },
  111792. "attributes": {
  111793. "module_not_derived": "00000000000000000000000000000001",
  111794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111795. },
  111796. "port_directions": {
  111797. "C": "input",
  111798. "D": "input",
  111799. "E": "input",
  111800. "Q": "output"
  111801. },
  111802. "connections": {
  111803. "C": [ 42 ],
  111804. "D": [ 4308 ],
  111805. "E": [ 3995 ],
  111806. "Q": [ 1931 ]
  111807. }
  111808. },
  111809. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_1": {
  111810. "hide_name": 0,
  111811. "type": "SB_DFFE",
  111812. "parameters": {
  111813. },
  111814. "attributes": {
  111815. "module_not_derived": "00000000000000000000000000000001",
  111816. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111817. },
  111818. "port_directions": {
  111819. "C": "input",
  111820. "D": "input",
  111821. "E": "input",
  111822. "Q": "output"
  111823. },
  111824. "connections": {
  111825. "C": [ 42 ],
  111826. "D": [ 4366 ],
  111827. "E": [ 3995 ],
  111828. "Q": [ 1916 ]
  111829. }
  111830. },
  111831. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_10": {
  111832. "hide_name": 0,
  111833. "type": "SB_DFFE",
  111834. "parameters": {
  111835. },
  111836. "attributes": {
  111837. "module_not_derived": "00000000000000000000000000000001",
  111838. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111839. },
  111840. "port_directions": {
  111841. "C": "input",
  111842. "D": "input",
  111843. "E": "input",
  111844. "Q": "output"
  111845. },
  111846. "connections": {
  111847. "C": [ 42 ],
  111848. "D": [ 4331 ],
  111849. "E": [ 3995 ],
  111850. "Q": [ 1852 ]
  111851. }
  111852. },
  111853. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_11": {
  111854. "hide_name": 0,
  111855. "type": "SB_DFFE",
  111856. "parameters": {
  111857. },
  111858. "attributes": {
  111859. "module_not_derived": "00000000000000000000000000000001",
  111860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111861. },
  111862. "port_directions": {
  111863. "C": "input",
  111864. "D": "input",
  111865. "E": "input",
  111866. "Q": "output"
  111867. },
  111868. "connections": {
  111869. "C": [ 42 ],
  111870. "D": [ 4328 ],
  111871. "E": [ 3995 ],
  111872. "Q": [ 1984 ]
  111873. }
  111874. },
  111875. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_12": {
  111876. "hide_name": 0,
  111877. "type": "SB_DFFE",
  111878. "parameters": {
  111879. },
  111880. "attributes": {
  111881. "module_not_derived": "00000000000000000000000000000001",
  111882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111883. },
  111884. "port_directions": {
  111885. "C": "input",
  111886. "D": "input",
  111887. "E": "input",
  111888. "Q": "output"
  111889. },
  111890. "connections": {
  111891. "C": [ 42 ],
  111892. "D": [ 4324 ],
  111893. "E": [ 3995 ],
  111894. "Q": [ 1977 ]
  111895. }
  111896. },
  111897. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_13": {
  111898. "hide_name": 0,
  111899. "type": "SB_DFFE",
  111900. "parameters": {
  111901. },
  111902. "attributes": {
  111903. "module_not_derived": "00000000000000000000000000000001",
  111904. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111905. },
  111906. "port_directions": {
  111907. "C": "input",
  111908. "D": "input",
  111909. "E": "input",
  111910. "Q": "output"
  111911. },
  111912. "connections": {
  111913. "C": [ 42 ],
  111914. "D": [ 4316 ],
  111915. "E": [ 3995 ],
  111916. "Q": [ 1970 ]
  111917. }
  111918. },
  111919. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_14": {
  111920. "hide_name": 0,
  111921. "type": "SB_DFFE",
  111922. "parameters": {
  111923. },
  111924. "attributes": {
  111925. "module_not_derived": "00000000000000000000000000000001",
  111926. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111927. },
  111928. "port_directions": {
  111929. "C": "input",
  111930. "D": "input",
  111931. "E": "input",
  111932. "Q": "output"
  111933. },
  111934. "connections": {
  111935. "C": [ 42 ],
  111936. "D": [ 4429 ],
  111937. "E": [ 3995 ],
  111938. "Q": [ 1963 ]
  111939. }
  111940. },
  111941. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_15": {
  111942. "hide_name": 0,
  111943. "type": "SB_DFFE",
  111944. "parameters": {
  111945. },
  111946. "attributes": {
  111947. "module_not_derived": "00000000000000000000000000000001",
  111948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111949. },
  111950. "port_directions": {
  111951. "C": "input",
  111952. "D": "input",
  111953. "E": "input",
  111954. "Q": "output"
  111955. },
  111956. "connections": {
  111957. "C": [ 42 ],
  111958. "D": [ 4427 ],
  111959. "E": [ 3995 ],
  111960. "Q": [ 1956 ]
  111961. }
  111962. },
  111963. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_16": {
  111964. "hide_name": 0,
  111965. "type": "SB_DFFE",
  111966. "parameters": {
  111967. },
  111968. "attributes": {
  111969. "module_not_derived": "00000000000000000000000000000001",
  111970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111971. },
  111972. "port_directions": {
  111973. "C": "input",
  111974. "D": "input",
  111975. "E": "input",
  111976. "Q": "output"
  111977. },
  111978. "connections": {
  111979. "C": [ 42 ],
  111980. "D": [ 4422 ],
  111981. "E": [ 3995 ],
  111982. "Q": [ 1949 ]
  111983. }
  111984. },
  111985. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_17": {
  111986. "hide_name": 0,
  111987. "type": "SB_DFFE",
  111988. "parameters": {
  111989. },
  111990. "attributes": {
  111991. "module_not_derived": "00000000000000000000000000000001",
  111992. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  111993. },
  111994. "port_directions": {
  111995. "C": "input",
  111996. "D": "input",
  111997. "E": "input",
  111998. "Q": "output"
  111999. },
  112000. "connections": {
  112001. "C": [ 42 ],
  112002. "D": [ 4417 ],
  112003. "E": [ 3995 ],
  112004. "Q": [ 1942 ]
  112005. }
  112006. },
  112007. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_18": {
  112008. "hide_name": 0,
  112009. "type": "SB_DFFE",
  112010. "parameters": {
  112011. },
  112012. "attributes": {
  112013. "module_not_derived": "00000000000000000000000000000001",
  112014. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112015. },
  112016. "port_directions": {
  112017. "C": "input",
  112018. "D": "input",
  112019. "E": "input",
  112020. "Q": "output"
  112021. },
  112022. "connections": {
  112023. "C": [ 42 ],
  112024. "D": [ 4412 ],
  112025. "E": [ 3995 ],
  112026. "Q": [ 1935 ]
  112027. }
  112028. },
  112029. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_19": {
  112030. "hide_name": 0,
  112031. "type": "SB_DFFE",
  112032. "parameters": {
  112033. },
  112034. "attributes": {
  112035. "module_not_derived": "00000000000000000000000000000001",
  112036. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112037. },
  112038. "port_directions": {
  112039. "C": "input",
  112040. "D": "input",
  112041. "E": "input",
  112042. "Q": "output"
  112043. },
  112044. "connections": {
  112045. "C": [ 42 ],
  112046. "D": [ 4407 ],
  112047. "E": [ 3995 ],
  112048. "Q": [ 1920 ]
  112049. }
  112050. },
  112051. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_2": {
  112052. "hide_name": 0,
  112053. "type": "SB_DFFE",
  112054. "parameters": {
  112055. },
  112056. "attributes": {
  112057. "module_not_derived": "00000000000000000000000000000001",
  112058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112059. },
  112060. "port_directions": {
  112061. "C": "input",
  112062. "D": "input",
  112063. "E": "input",
  112064. "Q": "output"
  112065. },
  112066. "connections": {
  112067. "C": [ 42 ],
  112068. "D": [ 4364 ],
  112069. "E": [ 3995 ],
  112070. "Q": [ 1909 ]
  112071. }
  112072. },
  112073. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_20": {
  112074. "hide_name": 0,
  112075. "type": "SB_DFFE",
  112076. "parameters": {
  112077. },
  112078. "attributes": {
  112079. "module_not_derived": "00000000000000000000000000000001",
  112080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112081. },
  112082. "port_directions": {
  112083. "C": "input",
  112084. "D": "input",
  112085. "E": "input",
  112086. "Q": "output"
  112087. },
  112088. "connections": {
  112089. "C": [ 42 ],
  112090. "D": [ 4401 ],
  112091. "E": [ 3995 ],
  112092. "Q": [ 1817 ]
  112093. }
  112094. },
  112095. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_21": {
  112096. "hide_name": 0,
  112097. "type": "SB_DFFE",
  112098. "parameters": {
  112099. },
  112100. "attributes": {
  112101. "module_not_derived": "00000000000000000000000000000001",
  112102. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112103. },
  112104. "port_directions": {
  112105. "C": "input",
  112106. "D": "input",
  112107. "E": "input",
  112108. "Q": "output"
  112109. },
  112110. "connections": {
  112111. "C": [ 42 ],
  112112. "D": [ 4358 ],
  112113. "E": [ 3995 ],
  112114. "Q": [ 1430 ]
  112115. }
  112116. },
  112117. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_22": {
  112118. "hide_name": 0,
  112119. "type": "SB_DFFE",
  112120. "parameters": {
  112121. },
  112122. "attributes": {
  112123. "module_not_derived": "00000000000000000000000000000001",
  112124. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112125. },
  112126. "port_directions": {
  112127. "C": "input",
  112128. "D": "input",
  112129. "E": "input",
  112130. "Q": "output"
  112131. },
  112132. "connections": {
  112133. "C": [ 42 ],
  112134. "D": [ 4312 ],
  112135. "E": [ 3995 ],
  112136. "Q": [ 1373 ]
  112137. }
  112138. },
  112139. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_23": {
  112140. "hide_name": 0,
  112141. "type": "SB_DFFE",
  112142. "parameters": {
  112143. },
  112144. "attributes": {
  112145. "module_not_derived": "00000000000000000000000000000001",
  112146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112147. },
  112148. "port_directions": {
  112149. "C": "input",
  112150. "D": "input",
  112151. "E": "input",
  112152. "Q": "output"
  112153. },
  112154. "connections": {
  112155. "C": [ 42 ],
  112156. "D": [ 4397 ],
  112157. "E": [ 3995 ],
  112158. "Q": [ 1390 ]
  112159. }
  112160. },
  112161. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_24": {
  112162. "hide_name": 0,
  112163. "type": "SB_DFFE",
  112164. "parameters": {
  112165. },
  112166. "attributes": {
  112167. "module_not_derived": "00000000000000000000000000000001",
  112168. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112169. },
  112170. "port_directions": {
  112171. "C": "input",
  112172. "D": "input",
  112173. "E": "input",
  112174. "Q": "output"
  112175. },
  112176. "connections": {
  112177. "C": [ 42 ],
  112178. "D": [ 4396 ],
  112179. "E": [ 3995 ],
  112180. "Q": [ 1401 ]
  112181. }
  112182. },
  112183. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_25": {
  112184. "hide_name": 0,
  112185. "type": "SB_DFFE",
  112186. "parameters": {
  112187. },
  112188. "attributes": {
  112189. "module_not_derived": "00000000000000000000000000000001",
  112190. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112191. },
  112192. "port_directions": {
  112193. "C": "input",
  112194. "D": "input",
  112195. "E": "input",
  112196. "Q": "output"
  112197. },
  112198. "connections": {
  112199. "C": [ 42 ],
  112200. "D": [ 4392 ],
  112201. "E": [ 3995 ],
  112202. "Q": [ 1411 ]
  112203. }
  112204. },
  112205. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_26": {
  112206. "hide_name": 0,
  112207. "type": "SB_DFFE",
  112208. "parameters": {
  112209. },
  112210. "attributes": {
  112211. "module_not_derived": "00000000000000000000000000000001",
  112212. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112213. },
  112214. "port_directions": {
  112215. "C": "input",
  112216. "D": "input",
  112217. "E": "input",
  112218. "Q": "output"
  112219. },
  112220. "connections": {
  112221. "C": [ 42 ],
  112222. "D": [ 4388 ],
  112223. "E": [ 3995 ],
  112224. "Q": [ 1420 ]
  112225. }
  112226. },
  112227. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_27": {
  112228. "hide_name": 0,
  112229. "type": "SB_DFFE",
  112230. "parameters": {
  112231. },
  112232. "attributes": {
  112233. "module_not_derived": "00000000000000000000000000000001",
  112234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112235. },
  112236. "port_directions": {
  112237. "C": "input",
  112238. "D": "input",
  112239. "E": "input",
  112240. "Q": "output"
  112241. },
  112242. "connections": {
  112243. "C": [ 42 ],
  112244. "D": [ 4384 ],
  112245. "E": [ 3995 ],
  112246. "Q": [ 1444 ]
  112247. }
  112248. },
  112249. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_28": {
  112250. "hide_name": 0,
  112251. "type": "SB_DFFE",
  112252. "parameters": {
  112253. },
  112254. "attributes": {
  112255. "module_not_derived": "00000000000000000000000000000001",
  112256. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112257. },
  112258. "port_directions": {
  112259. "C": "input",
  112260. "D": "input",
  112261. "E": "input",
  112262. "Q": "output"
  112263. },
  112264. "connections": {
  112265. "C": [ 42 ],
  112266. "D": [ 4380 ],
  112267. "E": [ 3995 ],
  112268. "Q": [ 1454 ]
  112269. }
  112270. },
  112271. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_29": {
  112272. "hide_name": 0,
  112273. "type": "SB_DFFE",
  112274. "parameters": {
  112275. },
  112276. "attributes": {
  112277. "module_not_derived": "00000000000000000000000000000001",
  112278. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112279. },
  112280. "port_directions": {
  112281. "C": "input",
  112282. "D": "input",
  112283. "E": "input",
  112284. "Q": "output"
  112285. },
  112286. "connections": {
  112287. "C": [ 42 ],
  112288. "D": [ 4370 ],
  112289. "E": [ 3995 ],
  112290. "Q": [ 1459 ]
  112291. }
  112292. },
  112293. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_3": {
  112294. "hide_name": 0,
  112295. "type": "SB_DFFE",
  112296. "parameters": {
  112297. },
  112298. "attributes": {
  112299. "module_not_derived": "00000000000000000000000000000001",
  112300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112301. },
  112302. "port_directions": {
  112303. "C": "input",
  112304. "D": "input",
  112305. "E": "input",
  112306. "Q": "output"
  112307. },
  112308. "connections": {
  112309. "C": [ 42 ],
  112310. "D": [ 4361 ],
  112311. "E": [ 3995 ],
  112312. "Q": [ 1902 ]
  112313. }
  112314. },
  112315. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_4": {
  112316. "hide_name": 0,
  112317. "type": "SB_DFFE",
  112318. "parameters": {
  112319. },
  112320. "attributes": {
  112321. "module_not_derived": "00000000000000000000000000000001",
  112322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112323. },
  112324. "port_directions": {
  112325. "C": "input",
  112326. "D": "input",
  112327. "E": "input",
  112328. "Q": "output"
  112329. },
  112330. "connections": {
  112331. "C": [ 42 ],
  112332. "D": [ 4349 ],
  112333. "E": [ 3995 ],
  112334. "Q": [ 1895 ]
  112335. }
  112336. },
  112337. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_5": {
  112338. "hide_name": 0,
  112339. "type": "SB_DFFE",
  112340. "parameters": {
  112341. },
  112342. "attributes": {
  112343. "module_not_derived": "00000000000000000000000000000001",
  112344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112345. },
  112346. "port_directions": {
  112347. "C": "input",
  112348. "D": "input",
  112349. "E": "input",
  112350. "Q": "output"
  112351. },
  112352. "connections": {
  112353. "C": [ 42 ],
  112354. "D": [ 4346 ],
  112355. "E": [ 3995 ],
  112356. "Q": [ 1888 ]
  112357. }
  112358. },
  112359. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_6": {
  112360. "hide_name": 0,
  112361. "type": "SB_DFFE",
  112362. "parameters": {
  112363. },
  112364. "attributes": {
  112365. "module_not_derived": "00000000000000000000000000000001",
  112366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112367. },
  112368. "port_directions": {
  112369. "C": "input",
  112370. "D": "input",
  112371. "E": "input",
  112372. "Q": "output"
  112373. },
  112374. "connections": {
  112375. "C": [ 42 ],
  112376. "D": [ 4343 ],
  112377. "E": [ 3995 ],
  112378. "Q": [ 1881 ]
  112379. }
  112380. },
  112381. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_7": {
  112382. "hide_name": 0,
  112383. "type": "SB_DFFE",
  112384. "parameters": {
  112385. },
  112386. "attributes": {
  112387. "module_not_derived": "00000000000000000000000000000001",
  112388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112389. },
  112390. "port_directions": {
  112391. "C": "input",
  112392. "D": "input",
  112393. "E": "input",
  112394. "Q": "output"
  112395. },
  112396. "connections": {
  112397. "C": [ 42 ],
  112398. "D": [ 4340 ],
  112399. "E": [ 3995 ],
  112400. "Q": [ 1874 ]
  112401. }
  112402. },
  112403. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_8": {
  112404. "hide_name": 0,
  112405. "type": "SB_DFFE",
  112406. "parameters": {
  112407. },
  112408. "attributes": {
  112409. "module_not_derived": "00000000000000000000000000000001",
  112410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112411. },
  112412. "port_directions": {
  112413. "C": "input",
  112414. "D": "input",
  112415. "E": "input",
  112416. "Q": "output"
  112417. },
  112418. "connections": {
  112419. "C": [ 42 ],
  112420. "D": [ 4337 ],
  112421. "E": [ 3995 ],
  112422. "Q": [ 1867 ]
  112423. }
  112424. },
  112425. "cpu_I.execute_to_memory_BRANCH_CALC_SB_DFFE_Q_9": {
  112426. "hide_name": 0,
  112427. "type": "SB_DFFE",
  112428. "parameters": {
  112429. },
  112430. "attributes": {
  112431. "module_not_derived": "00000000000000000000000000000001",
  112432. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112433. },
  112434. "port_directions": {
  112435. "C": "input",
  112436. "D": "input",
  112437. "E": "input",
  112438. "Q": "output"
  112439. },
  112440. "connections": {
  112441. "C": [ 42 ],
  112442. "D": [ 4334 ],
  112443. "E": [ 3995 ],
  112444. "Q": [ 1860 ]
  112445. }
  112446. },
  112447. "cpu_I.execute_to_memory_BRANCH_DO_SB_DFFE_Q": {
  112448. "hide_name": 0,
  112449. "type": "SB_DFFE",
  112450. "parameters": {
  112451. },
  112452. "attributes": {
  112453. "module_not_derived": "00000000000000000000000000000001",
  112454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112455. },
  112456. "port_directions": {
  112457. "C": "input",
  112458. "D": "input",
  112459. "E": "input",
  112460. "Q": "output"
  112461. },
  112462. "connections": {
  112463. "C": [ 42 ],
  112464. "D": [ 4284 ],
  112465. "E": [ 3995 ],
  112466. "Q": [ 4893 ]
  112467. }
  112468. },
  112469. "cpu_I.execute_to_memory_BRANCH_DO_SB_LUT4_I2": {
  112470. "hide_name": 0,
  112471. "type": "SB_LUT4",
  112472. "parameters": {
  112473. "LUT_INIT": "1111000000000000"
  112474. },
  112475. "attributes": {
  112476. "module_not_derived": "00000000000000000000000000000001",
  112477. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  112478. },
  112479. "port_directions": {
  112480. "I0": "input",
  112481. "I1": "input",
  112482. "I2": "input",
  112483. "I3": "input",
  112484. "O": "output"
  112485. },
  112486. "connections": {
  112487. "I0": [ "0" ],
  112488. "I1": [ "0" ],
  112489. "I2": [ 4893 ],
  112490. "I3": [ 3090 ],
  112491. "O": [ 1391 ]
  112492. }
  112493. },
  112494. "cpu_I.execute_to_memory_BRANCH_DO_SB_LUT4_I2_O_SB_LUT4_O": {
  112495. "hide_name": 0,
  112496. "type": "SB_LUT4",
  112497. "parameters": {
  112498. "LUT_INIT": "1111000011111111"
  112499. },
  112500. "attributes": {
  112501. "module_not_derived": "00000000000000000000000000000001",
  112502. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  112503. },
  112504. "port_directions": {
  112505. "I0": "input",
  112506. "I1": "input",
  112507. "I2": "input",
  112508. "I3": "input",
  112509. "O": "output"
  112510. },
  112511. "connections": {
  112512. "I0": [ "0" ],
  112513. "I1": [ "0" ],
  112514. "I2": [ 4449 ],
  112515. "I3": [ 1052 ],
  112516. "O": [ 1023 ]
  112517. }
  112518. },
  112519. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_DFFE_Q": {
  112520. "hide_name": 0,
  112521. "type": "SB_DFFE",
  112522. "parameters": {
  112523. },
  112524. "attributes": {
  112525. "module_not_derived": "00000000000000000000000000000001",
  112526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112527. },
  112528. "port_directions": {
  112529. "C": "input",
  112530. "D": "input",
  112531. "E": "input",
  112532. "Q": "output"
  112533. },
  112534. "connections": {
  112535. "C": [ 42 ],
  112536. "D": [ 3974 ],
  112537. "E": [ 3995 ],
  112538. "Q": [ 4894 ]
  112539. }
  112540. },
  112541. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0": {
  112542. "hide_name": 0,
  112543. "type": "SB_LUT4",
  112544. "parameters": {
  112545. "LUT_INIT": "1000000000000000"
  112546. },
  112547. "attributes": {
  112548. "module_not_derived": "00000000000000000000000000000001",
  112549. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112550. },
  112551. "port_directions": {
  112552. "I0": "input",
  112553. "I1": "input",
  112554. "I2": "input",
  112555. "I3": "input",
  112556. "O": "output"
  112557. },
  112558. "connections": {
  112559. "I0": [ 4894 ],
  112560. "I1": [ 4895 ],
  112561. "I2": [ 3090 ],
  112562. "I3": [ 3282 ],
  112563. "O": [ 3715 ]
  112564. }
  112565. },
  112566. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1": {
  112567. "hide_name": 0,
  112568. "type": "SB_LUT4",
  112569. "parameters": {
  112570. "LUT_INIT": "1000000000000000"
  112571. },
  112572. "attributes": {
  112573. "module_not_derived": "00000000000000000000000000000001",
  112574. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112575. },
  112576. "port_directions": {
  112577. "I0": "input",
  112578. "I1": "input",
  112579. "I2": "input",
  112580. "I3": "input",
  112581. "O": "output"
  112582. },
  112583. "connections": {
  112584. "I0": [ 4894 ],
  112585. "I1": [ 4895 ],
  112586. "I2": [ 3090 ],
  112587. "I3": [ 3970 ],
  112588. "O": [ 3848 ]
  112589. }
  112590. },
  112591. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_I3_SB_LUT4_O": {
  112592. "hide_name": 0,
  112593. "type": "SB_LUT4",
  112594. "parameters": {
  112595. "LUT_INIT": "1000000000000000"
  112596. },
  112597. "attributes": {
  112598. "module_not_derived": "00000000000000000000000000000001",
  112599. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112600. },
  112601. "port_directions": {
  112602. "I0": "input",
  112603. "I1": "input",
  112604. "I2": "input",
  112605. "I3": "input",
  112606. "O": "output"
  112607. },
  112608. "connections": {
  112609. "I0": [ 4275 ],
  112610. "I1": [ 4276 ],
  112611. "I2": [ 4269 ],
  112612. "I3": [ 4274 ],
  112613. "O": [ 3971 ]
  112614. }
  112615. },
  112616. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_I3_SB_LUT4_O_1": {
  112617. "hide_name": 0,
  112618. "type": "SB_LUT4",
  112619. "parameters": {
  112620. "LUT_INIT": "1001000000000000"
  112621. },
  112622. "attributes": {
  112623. "module_not_derived": "00000000000000000000000000000001",
  112624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112625. },
  112626. "port_directions": {
  112627. "I0": "input",
  112628. "I1": "input",
  112629. "I2": "input",
  112630. "I3": "input",
  112631. "O": "output"
  112632. },
  112633. "connections": {
  112634. "I0": [ 1552 ],
  112635. "I1": [ 4896 ],
  112636. "I2": [ 4897 ],
  112637. "I3": [ 4898 ],
  112638. "O": [ 3970 ]
  112639. }
  112640. },
  112641. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_I3_SB_LUT4_O_1_I2_SB_LUT4_O": {
  112642. "hide_name": 0,
  112643. "type": "SB_LUT4",
  112644. "parameters": {
  112645. "LUT_INIT": "1000010000100001"
  112646. },
  112647. "attributes": {
  112648. "module_not_derived": "00000000000000000000000000000001",
  112649. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112650. },
  112651. "port_directions": {
  112652. "I0": "input",
  112653. "I1": "input",
  112654. "I2": "input",
  112655. "I3": "input",
  112656. "O": "output"
  112657. },
  112658. "connections": {
  112659. "I0": [ 1551 ],
  112660. "I1": [ 1530 ],
  112661. "I2": [ 4899 ],
  112662. "I3": [ 4900 ],
  112663. "O": [ 4897 ]
  112664. }
  112665. },
  112666. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_I3_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  112667. "hide_name": 0,
  112668. "type": "SB_LUT4",
  112669. "parameters": {
  112670. "LUT_INIT": "1000010000100001"
  112671. },
  112672. "attributes": {
  112673. "module_not_derived": "00000000000000000000000000000001",
  112674. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112675. },
  112676. "port_directions": {
  112677. "I0": "input",
  112678. "I1": "input",
  112679. "I2": "input",
  112680. "I3": "input",
  112681. "O": "output"
  112682. },
  112683. "connections": {
  112684. "I0": [ 1549 ],
  112685. "I1": [ 1550 ],
  112686. "I2": [ 4901 ],
  112687. "I3": [ 4902 ],
  112688. "O": [ 4898 ]
  112689. }
  112690. },
  112691. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_O_SB_LUT4_O": {
  112692. "hide_name": 0,
  112693. "type": "SB_LUT4",
  112694. "parameters": {
  112695. "LUT_INIT": "1111110000110000"
  112696. },
  112697. "attributes": {
  112698. "module_not_derived": "00000000000000000000000000000001",
  112699. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  112700. },
  112701. "port_directions": {
  112702. "I0": "input",
  112703. "I1": "input",
  112704. "I2": "input",
  112705. "I3": "input",
  112706. "O": "output"
  112707. },
  112708. "connections": {
  112709. "I0": [ "0" ],
  112710. "I1": [ 2112 ],
  112711. "I2": [ 2318 ],
  112712. "I3": [ 2296 ],
  112713. "O": [ 3972 ]
  112714. }
  112715. },
  112716. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_O_SB_LUT4_O": {
  112717. "hide_name": 0,
  112718. "type": "SB_LUT4",
  112719. "parameters": {
  112720. "LUT_INIT": "0011000011111100"
  112721. },
  112722. "attributes": {
  112723. "module_not_derived": "00000000000000000000000000000001",
  112724. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  112725. },
  112726. "port_directions": {
  112727. "I0": "input",
  112728. "I1": "input",
  112729. "I2": "input",
  112730. "I3": "input",
  112731. "O": "output"
  112732. },
  112733. "connections": {
  112734. "I0": [ "0" ],
  112735. "I1": [ 2323 ],
  112736. "I2": [ 2324 ],
  112737. "I3": [ 2294 ],
  112738. "O": [ 3973 ]
  112739. }
  112740. },
  112741. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1": {
  112742. "hide_name": 0,
  112743. "type": "SB_LUT4",
  112744. "parameters": {
  112745. "LUT_INIT": "0011000000000000"
  112746. },
  112747. "attributes": {
  112748. "module_not_derived": "00000000000000000000000000000001",
  112749. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  112750. },
  112751. "port_directions": {
  112752. "I0": "input",
  112753. "I1": "input",
  112754. "I2": "input",
  112755. "I3": "input",
  112756. "O": "output"
  112757. },
  112758. "connections": {
  112759. "I0": [ "0" ],
  112760. "I1": [ 4894 ],
  112761. "I2": [ 4895 ],
  112762. "I3": [ 3090 ],
  112763. "O": [ 3281 ]
  112764. }
  112765. },
  112766. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O": {
  112767. "hide_name": 0,
  112768. "type": "SB_LUT4",
  112769. "parameters": {
  112770. "LUT_INIT": "1001000000000000"
  112771. },
  112772. "attributes": {
  112773. "module_not_derived": "00000000000000000000000000000001",
  112774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112775. },
  112776. "port_directions": {
  112777. "I0": "input",
  112778. "I1": "input",
  112779. "I2": "input",
  112780. "I3": "input",
  112781. "O": "output"
  112782. },
  112783. "connections": {
  112784. "I0": [ 1535 ],
  112785. "I1": [ 978 ],
  112786. "I2": [ 4903 ],
  112787. "I3": [ 4272 ],
  112788. "O": [ 3283 ]
  112789. }
  112790. },
  112791. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O_1": {
  112792. "hide_name": 0,
  112793. "type": "SB_LUT4",
  112794. "parameters": {
  112795. "LUT_INIT": "1001000000000000"
  112796. },
  112797. "attributes": {
  112798. "module_not_derived": "00000000000000000000000000000001",
  112799. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112800. },
  112801. "port_directions": {
  112802. "I0": "input",
  112803. "I1": "input",
  112804. "I2": "input",
  112805. "I3": "input",
  112806. "O": "output"
  112807. },
  112808. "connections": {
  112809. "I0": [ 1534 ],
  112810. "I1": [ 4896 ],
  112811. "I2": [ 4904 ],
  112812. "I3": [ 4905 ],
  112813. "O": [ 3282 ]
  112814. }
  112815. },
  112816. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O_1_I2_SB_LUT4_O": {
  112817. "hide_name": 0,
  112818. "type": "SB_LUT4",
  112819. "parameters": {
  112820. "LUT_INIT": "1000010000100001"
  112821. },
  112822. "attributes": {
  112823. "module_not_derived": "00000000000000000000000000000001",
  112824. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112825. },
  112826. "port_directions": {
  112827. "I0": "input",
  112828. "I1": "input",
  112829. "I2": "input",
  112830. "I3": "input",
  112831. "O": "output"
  112832. },
  112833. "connections": {
  112834. "I0": [ 1531 ],
  112835. "I1": [ 1533 ],
  112836. "I2": [ 4901 ],
  112837. "I3": [ 4899 ],
  112838. "O": [ 4904 ]
  112839. }
  112840. },
  112841. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O_1_I2_SB_LUT4_O_1": {
  112842. "hide_name": 0,
  112843. "type": "SB_LUT4",
  112844. "parameters": {
  112845. "LUT_INIT": "1000010000100001"
  112846. },
  112847. "attributes": {
  112848. "module_not_derived": "00000000000000000000000000000001",
  112849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112850. },
  112851. "port_directions": {
  112852. "I0": "input",
  112853. "I1": "input",
  112854. "I2": "input",
  112855. "I3": "input",
  112856. "O": "output"
  112857. },
  112858. "connections": {
  112859. "I0": [ 1532 ],
  112860. "I1": [ 1535 ],
  112861. "I2": [ 4902 ],
  112862. "I3": [ 4900 ],
  112863. "O": [ 4905 ]
  112864. }
  112865. },
  112866. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O_I2_SB_LUT4_O": {
  112867. "hide_name": 0,
  112868. "type": "SB_LUT4",
  112869. "parameters": {
  112870. "LUT_INIT": "1100010011110101"
  112871. },
  112872. "attributes": {
  112873. "module_not_derived": "00000000000000000000000000000001",
  112874. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  112875. },
  112876. "port_directions": {
  112877. "I0": "input",
  112878. "I1": "input",
  112879. "I2": "input",
  112880. "I3": "input",
  112881. "O": "output"
  112882. },
  112883. "connections": {
  112884. "I0": [ 1531 ],
  112885. "I1": [ 1532 ],
  112886. "I2": [ 970 ],
  112887. "I3": [ 972 ],
  112888. "O": [ 4903 ]
  112889. }
  112890. },
  112891. "cpu_I.execute_to_memory_ENV_CTRL_SB_DFFE_Q": {
  112892. "hide_name": 0,
  112893. "type": "SB_DFFE",
  112894. "parameters": {
  112895. },
  112896. "attributes": {
  112897. "module_not_derived": "00000000000000000000000000000001",
  112898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112899. },
  112900. "port_directions": {
  112901. "C": "input",
  112902. "D": "input",
  112903. "E": "input",
  112904. "Q": "output"
  112905. },
  112906. "connections": {
  112907. "C": [ 42 ],
  112908. "D": [ 1239 ],
  112909. "E": [ 3995 ],
  112910. "Q": [ 4906 ]
  112911. }
  112912. },
  112913. "cpu_I.execute_to_memory_ENV_CTRL_SB_DFFE_Q_1": {
  112914. "hide_name": 0,
  112915. "type": "SB_DFFE",
  112916. "parameters": {
  112917. },
  112918. "attributes": {
  112919. "module_not_derived": "00000000000000000000000000000001",
  112920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112921. },
  112922. "port_directions": {
  112923. "C": "input",
  112924. "D": "input",
  112925. "E": "input",
  112926. "Q": "output"
  112927. },
  112928. "connections": {
  112929. "C": [ 42 ],
  112930. "D": [ 1240 ],
  112931. "E": [ 3995 ],
  112932. "Q": [ 4907 ]
  112933. }
  112934. },
  112935. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q": {
  112936. "hide_name": 0,
  112937. "type": "SB_DFFE",
  112938. "parameters": {
  112939. },
  112940. "attributes": {
  112941. "module_not_derived": "00000000000000000000000000000001",
  112942. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112943. },
  112944. "port_directions": {
  112945. "C": "input",
  112946. "D": "input",
  112947. "E": "input",
  112948. "Q": "output"
  112949. },
  112950. "connections": {
  112951. "C": [ 42 ],
  112952. "D": [ 968 ],
  112953. "E": [ 3995 ],
  112954. "Q": [ 4450 ]
  112955. }
  112956. },
  112957. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_1": {
  112958. "hide_name": 0,
  112959. "type": "SB_DFFE",
  112960. "parameters": {
  112961. },
  112962. "attributes": {
  112963. "module_not_derived": "00000000000000000000000000000001",
  112964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112965. },
  112966. "port_directions": {
  112967. "C": "input",
  112968. "D": "input",
  112969. "E": "input",
  112970. "Q": "output"
  112971. },
  112972. "connections": {
  112973. "C": [ 42 ],
  112974. "D": [ 990 ],
  112975. "E": [ 3995 ],
  112976. "Q": [ 4451 ]
  112977. }
  112978. },
  112979. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_2": {
  112980. "hide_name": 0,
  112981. "type": "SB_DFFE",
  112982. "parameters": {
  112983. },
  112984. "attributes": {
  112985. "module_not_derived": "00000000000000000000000000000001",
  112986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  112987. },
  112988. "port_directions": {
  112989. "C": "input",
  112990. "D": "input",
  112991. "E": "input",
  112992. "Q": "output"
  112993. },
  112994. "connections": {
  112995. "C": [ 42 ],
  112996. "D": [ 962 ],
  112997. "E": [ 3995 ],
  112998. "Q": [ 3423 ]
  112999. }
  113000. },
  113001. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_3": {
  113002. "hide_name": 0,
  113003. "type": "SB_DFFE",
  113004. "parameters": {
  113005. },
  113006. "attributes": {
  113007. "module_not_derived": "00000000000000000000000000000001",
  113008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113009. },
  113010. "port_directions": {
  113011. "C": "input",
  113012. "D": "input",
  113013. "E": "input",
  113014. "Q": "output"
  113015. },
  113016. "connections": {
  113017. "C": [ 42 ],
  113018. "D": [ 964 ],
  113019. "E": [ 3995 ],
  113020. "Q": [ 2602 ]
  113021. }
  113022. },
  113023. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_4": {
  113024. "hide_name": 0,
  113025. "type": "SB_DFFE",
  113026. "parameters": {
  113027. },
  113028. "attributes": {
  113029. "module_not_derived": "00000000000000000000000000000001",
  113030. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113031. },
  113032. "port_directions": {
  113033. "C": "input",
  113034. "D": "input",
  113035. "E": "input",
  113036. "Q": "output"
  113037. },
  113038. "connections": {
  113039. "C": [ 42 ],
  113040. "D": [ 966 ],
  113041. "E": [ 3995 ],
  113042. "Q": [ 3424 ]
  113043. }
  113044. },
  113045. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_5": {
  113046. "hide_name": 0,
  113047. "type": "SB_DFFE",
  113048. "parameters": {
  113049. },
  113050. "attributes": {
  113051. "module_not_derived": "00000000000000000000000000000001",
  113052. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113053. },
  113054. "port_directions": {
  113055. "C": "input",
  113056. "D": "input",
  113057. "E": "input",
  113058. "Q": "output"
  113059. },
  113060. "connections": {
  113061. "C": [ 42 ],
  113062. "D": [ 970 ],
  113063. "E": [ 3995 ],
  113064. "Q": [ 4901 ]
  113065. }
  113066. },
  113067. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_6": {
  113068. "hide_name": 0,
  113069. "type": "SB_DFFE",
  113070. "parameters": {
  113071. },
  113072. "attributes": {
  113073. "module_not_derived": "00000000000000000000000000000001",
  113074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113075. },
  113076. "port_directions": {
  113077. "C": "input",
  113078. "D": "input",
  113079. "E": "input",
  113080. "Q": "output"
  113081. },
  113082. "connections": {
  113083. "C": [ 42 ],
  113084. "D": [ 972 ],
  113085. "E": [ 3995 ],
  113086. "Q": [ 4902 ]
  113087. }
  113088. },
  113089. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_7": {
  113090. "hide_name": 0,
  113091. "type": "SB_DFFE",
  113092. "parameters": {
  113093. },
  113094. "attributes": {
  113095. "module_not_derived": "00000000000000000000000000000001",
  113096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113097. },
  113098. "port_directions": {
  113099. "C": "input",
  113100. "D": "input",
  113101. "E": "input",
  113102. "Q": "output"
  113103. },
  113104. "connections": {
  113105. "C": [ 42 ],
  113106. "D": [ 974 ],
  113107. "E": [ 3995 ],
  113108. "Q": [ 4899 ]
  113109. }
  113110. },
  113111. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_8": {
  113112. "hide_name": 0,
  113113. "type": "SB_DFFE",
  113114. "parameters": {
  113115. },
  113116. "attributes": {
  113117. "module_not_derived": "00000000000000000000000000000001",
  113118. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113119. },
  113120. "port_directions": {
  113121. "C": "input",
  113122. "D": "input",
  113123. "E": "input",
  113124. "Q": "output"
  113125. },
  113126. "connections": {
  113127. "C": [ 42 ],
  113128. "D": [ 976 ],
  113129. "E": [ 3995 ],
  113130. "Q": [ 4896 ]
  113131. }
  113132. },
  113133. "cpu_I.execute_to_memory_INSTRUCTION_SB_DFFE_Q_9": {
  113134. "hide_name": 0,
  113135. "type": "SB_DFFE",
  113136. "parameters": {
  113137. },
  113138. "attributes": {
  113139. "module_not_derived": "00000000000000000000000000000001",
  113140. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113141. },
  113142. "port_directions": {
  113143. "C": "input",
  113144. "D": "input",
  113145. "E": "input",
  113146. "Q": "output"
  113147. },
  113148. "connections": {
  113149. "C": [ 42 ],
  113150. "D": [ 978 ],
  113151. "E": [ 3995 ],
  113152. "Q": [ 4900 ]
  113153. }
  113154. },
  113155. "cpu_I.execute_to_memory_IS_DIV_SB_DFFE_Q": {
  113156. "hide_name": 0,
  113157. "type": "SB_DFFE",
  113158. "parameters": {
  113159. },
  113160. "attributes": {
  113161. "module_not_derived": "00000000000000000000000000000001",
  113162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113163. },
  113164. "port_directions": {
  113165. "C": "input",
  113166. "D": "input",
  113167. "E": "input",
  113168. "Q": "output"
  113169. },
  113170. "connections": {
  113171. "C": [ 42 ],
  113172. "D": [ 3984 ],
  113173. "E": [ 3995 ],
  113174. "Q": [ 4908 ]
  113175. }
  113176. },
  113177. "cpu_I.execute_to_memory_IS_DIV_SB_LUT4_I2": {
  113178. "hide_name": 0,
  113179. "type": "SB_LUT4",
  113180. "parameters": {
  113181. "LUT_INIT": "1111000000000000"
  113182. },
  113183. "attributes": {
  113184. "module_not_derived": "00000000000000000000000000000001",
  113185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  113186. },
  113187. "port_directions": {
  113188. "I0": "input",
  113189. "I1": "input",
  113190. "I2": "input",
  113191. "I3": "input",
  113192. "O": "output"
  113193. },
  113194. "connections": {
  113195. "I0": [ "0" ],
  113196. "I1": [ "0" ],
  113197. "I2": [ 4908 ],
  113198. "I3": [ 3090 ],
  113199. "O": [ 3080 ]
  113200. }
  113201. },
  113202. "cpu_I.execute_to_memory_IS_MUL_SB_DFFE_Q": {
  113203. "hide_name": 0,
  113204. "type": "SB_DFFE",
  113205. "parameters": {
  113206. },
  113207. "attributes": {
  113208. "module_not_derived": "00000000000000000000000000000001",
  113209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113210. },
  113211. "port_directions": {
  113212. "C": "input",
  113213. "D": "input",
  113214. "E": "input",
  113215. "Q": "output"
  113216. },
  113217. "connections": {
  113218. "C": [ 42 ],
  113219. "D": [ 4136 ],
  113220. "E": [ 3995 ],
  113221. "Q": [ 4909 ]
  113222. }
  113223. },
  113224. "cpu_I.execute_to_memory_MEMORY_ADDRESS_LOW_SB_DFFE_Q": {
  113225. "hide_name": 0,
  113226. "type": "SB_DFFE",
  113227. "parameters": {
  113228. },
  113229. "attributes": {
  113230. "module_not_derived": "00000000000000000000000000000001",
  113231. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113232. },
  113233. "port_directions": {
  113234. "C": "input",
  113235. "D": "input",
  113236. "E": "input",
  113237. "Q": "output"
  113238. },
  113239. "connections": {
  113240. "C": [ 42 ],
  113241. "D": [ 3078 ],
  113242. "E": [ 3995 ],
  113243. "Q": [ 4910 ]
  113244. }
  113245. },
  113246. "cpu_I.execute_to_memory_MEMORY_ADDRESS_LOW_SB_DFFE_Q_1": {
  113247. "hide_name": 0,
  113248. "type": "SB_DFFE",
  113249. "parameters": {
  113250. },
  113251. "attributes": {
  113252. "module_not_derived": "00000000000000000000000000000001",
  113253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113254. },
  113255. "port_directions": {
  113256. "C": "input",
  113257. "D": "input",
  113258. "E": "input",
  113259. "Q": "output"
  113260. },
  113261. "connections": {
  113262. "C": [ 42 ],
  113263. "D": [ 2775 ],
  113264. "E": [ 3995 ],
  113265. "Q": [ 4911 ]
  113266. }
  113267. },
  113268. "cpu_I.execute_to_memory_MEMORY_ENABLE_SB_DFFE_Q": {
  113269. "hide_name": 0,
  113270. "type": "SB_DFFE",
  113271. "parameters": {
  113272. },
  113273. "attributes": {
  113274. "module_not_derived": "00000000000000000000000000000001",
  113275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113276. },
  113277. "port_directions": {
  113278. "C": "input",
  113279. "D": "input",
  113280. "E": "input",
  113281. "Q": "output"
  113282. },
  113283. "connections": {
  113284. "C": [ 42 ],
  113285. "D": [ 3980 ],
  113286. "E": [ 3995 ],
  113287. "Q": [ 4912 ]
  113288. }
  113289. },
  113290. "cpu_I.execute_to_memory_MEMORY_STORE_SB_DFFE_Q": {
  113291. "hide_name": 0,
  113292. "type": "SB_DFFE",
  113293. "parameters": {
  113294. },
  113295. "attributes": {
  113296. "module_not_derived": "00000000000000000000000000000001",
  113297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113298. },
  113299. "port_directions": {
  113300. "C": "input",
  113301. "D": "input",
  113302. "E": "input",
  113303. "Q": "output"
  113304. },
  113305. "connections": {
  113306. "C": [ 42 ],
  113307. "D": [ 982 ],
  113308. "E": [ 3995 ],
  113309. "Q": [ 4913 ]
  113310. }
  113311. },
  113312. "cpu_I.execute_to_memory_MEMORY_STORE_SB_LUT4_I0": {
  113313. "hide_name": 0,
  113314. "type": "SB_LUT4",
  113315. "parameters": {
  113316. "LUT_INIT": "0000000001000000"
  113317. },
  113318. "attributes": {
  113319. "module_not_derived": "00000000000000000000000000000001",
  113320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  113321. },
  113322. "port_directions": {
  113323. "I0": "input",
  113324. "I1": "input",
  113325. "I2": "input",
  113326. "I3": "input",
  113327. "O": "output"
  113328. },
  113329. "connections": {
  113330. "I0": [ 4913 ],
  113331. "I1": [ 4912 ],
  113332. "I2": [ 3090 ],
  113333. "I3": [ 4914 ],
  113334. "O": [ 4135 ]
  113335. }
  113336. },
  113337. "cpu_I.execute_to_memory_MEMORY_STORE_SB_LUT4_I0_I3_SB_LUT4_O": {
  113338. "hide_name": 0,
  113339. "type": "SB_LUT4",
  113340. "parameters": {
  113341. "LUT_INIT": "0100000001010000"
  113342. },
  113343. "attributes": {
  113344. "module_not_derived": "00000000000000000000000000000001",
  113345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  113346. },
  113347. "port_directions": {
  113348. "I0": "input",
  113349. "I1": "input",
  113350. "I2": "input",
  113351. "I3": "input",
  113352. "O": "output"
  113353. },
  113354. "connections": {
  113355. "I0": [ 469 ],
  113356. "I1": [ 914 ],
  113357. "I2": [ 740 ],
  113358. "I3": [ 937 ],
  113359. "O": [ 4914 ]
  113360. }
  113361. },
  113362. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q": {
  113363. "hide_name": 0,
  113364. "type": "SB_DFFE",
  113365. "parameters": {
  113366. },
  113367. "attributes": {
  113368. "module_not_derived": "00000000000000000000000000000001",
  113369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113370. },
  113371. "port_directions": {
  113372. "C": "input",
  113373. "D": "input",
  113374. "E": "input",
  113375. "Q": "output"
  113376. },
  113377. "connections": {
  113378. "C": [ 42 ],
  113379. "D": [ 4464 ],
  113380. "E": [ 3995 ],
  113381. "Q": [ 4915 ]
  113382. }
  113383. },
  113384. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_1": {
  113385. "hide_name": 0,
  113386. "type": "SB_DFFE",
  113387. "parameters": {
  113388. },
  113389. "attributes": {
  113390. "module_not_derived": "00000000000000000000000000000001",
  113391. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113392. },
  113393. "port_directions": {
  113394. "C": "input",
  113395. "D": "input",
  113396. "E": "input",
  113397. "Q": "output"
  113398. },
  113399. "connections": {
  113400. "C": [ 42 ],
  113401. "D": [ 4554 ],
  113402. "E": [ 3995 ],
  113403. "Q": [ 4916 ]
  113404. }
  113405. },
  113406. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_10": {
  113407. "hide_name": 0,
  113408. "type": "SB_DFFE",
  113409. "parameters": {
  113410. },
  113411. "attributes": {
  113412. "module_not_derived": "00000000000000000000000000000001",
  113413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113414. },
  113415. "port_directions": {
  113416. "C": "input",
  113417. "D": "input",
  113418. "E": "input",
  113419. "Q": "output"
  113420. },
  113421. "connections": {
  113422. "C": [ 42 ],
  113423. "D": [ 4489 ],
  113424. "E": [ 3995 ],
  113425. "Q": [ 4917 ]
  113426. }
  113427. },
  113428. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_11": {
  113429. "hide_name": 0,
  113430. "type": "SB_DFFE",
  113431. "parameters": {
  113432. },
  113433. "attributes": {
  113434. "module_not_derived": "00000000000000000000000000000001",
  113435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113436. },
  113437. "port_directions": {
  113438. "C": "input",
  113439. "D": "input",
  113440. "E": "input",
  113441. "Q": "output"
  113442. },
  113443. "connections": {
  113444. "C": [ 42 ],
  113445. "D": [ 4472 ],
  113446. "E": [ 3995 ],
  113447. "Q": [ 4918 ]
  113448. }
  113449. },
  113450. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_12": {
  113451. "hide_name": 0,
  113452. "type": "SB_DFFE",
  113453. "parameters": {
  113454. },
  113455. "attributes": {
  113456. "module_not_derived": "00000000000000000000000000000001",
  113457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113458. },
  113459. "port_directions": {
  113460. "C": "input",
  113461. "D": "input",
  113462. "E": "input",
  113463. "Q": "output"
  113464. },
  113465. "connections": {
  113466. "C": [ 42 ],
  113467. "D": [ 4564 ],
  113468. "E": [ 3995 ],
  113469. "Q": [ 4919 ]
  113470. }
  113471. },
  113472. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_13": {
  113473. "hide_name": 0,
  113474. "type": "SB_DFFE",
  113475. "parameters": {
  113476. },
  113477. "attributes": {
  113478. "module_not_derived": "00000000000000000000000000000001",
  113479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113480. },
  113481. "port_directions": {
  113482. "C": "input",
  113483. "D": "input",
  113484. "E": "input",
  113485. "Q": "output"
  113486. },
  113487. "connections": {
  113488. "C": [ 42 ],
  113489. "D": [ 4562 ],
  113490. "E": [ 3995 ],
  113491. "Q": [ 4920 ]
  113492. }
  113493. },
  113494. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_14": {
  113495. "hide_name": 0,
  113496. "type": "SB_DFFE",
  113497. "parameters": {
  113498. },
  113499. "attributes": {
  113500. "module_not_derived": "00000000000000000000000000000001",
  113501. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113502. },
  113503. "port_directions": {
  113504. "C": "input",
  113505. "D": "input",
  113506. "E": "input",
  113507. "Q": "output"
  113508. },
  113509. "connections": {
  113510. "C": [ 42 ],
  113511. "D": [ 4557 ],
  113512. "E": [ 3995 ],
  113513. "Q": [ 4921 ]
  113514. }
  113515. },
  113516. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_15": {
  113517. "hide_name": 0,
  113518. "type": "SB_DFFE",
  113519. "parameters": {
  113520. },
  113521. "attributes": {
  113522. "module_not_derived": "00000000000000000000000000000001",
  113523. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113524. },
  113525. "port_directions": {
  113526. "C": "input",
  113527. "D": "input",
  113528. "E": "input",
  113529. "Q": "output"
  113530. },
  113531. "connections": {
  113532. "C": [ 42 ],
  113533. "D": [ 4519 ],
  113534. "E": [ 3995 ],
  113535. "Q": [ 4922 ]
  113536. }
  113537. },
  113538. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_2": {
  113539. "hide_name": 0,
  113540. "type": "SB_DFFE",
  113541. "parameters": {
  113542. },
  113543. "attributes": {
  113544. "module_not_derived": "00000000000000000000000000000001",
  113545. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113546. },
  113547. "port_directions": {
  113548. "C": "input",
  113549. "D": "input",
  113550. "E": "input",
  113551. "Q": "output"
  113552. },
  113553. "connections": {
  113554. "C": [ 42 ],
  113555. "D": [ 4550 ],
  113556. "E": [ 3995 ],
  113557. "Q": [ 4923 ]
  113558. }
  113559. },
  113560. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_3": {
  113561. "hide_name": 0,
  113562. "type": "SB_DFFE",
  113563. "parameters": {
  113564. },
  113565. "attributes": {
  113566. "module_not_derived": "00000000000000000000000000000001",
  113567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113568. },
  113569. "port_directions": {
  113570. "C": "input",
  113571. "D": "input",
  113572. "E": "input",
  113573. "Q": "output"
  113574. },
  113575. "connections": {
  113576. "C": [ 42 ],
  113577. "D": [ 4546 ],
  113578. "E": [ 3995 ],
  113579. "Q": [ 4924 ]
  113580. }
  113581. },
  113582. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_4": {
  113583. "hide_name": 0,
  113584. "type": "SB_DFFE",
  113585. "parameters": {
  113586. },
  113587. "attributes": {
  113588. "module_not_derived": "00000000000000000000000000000001",
  113589. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113590. },
  113591. "port_directions": {
  113592. "C": "input",
  113593. "D": "input",
  113594. "E": "input",
  113595. "Q": "output"
  113596. },
  113597. "connections": {
  113598. "C": [ 42 ],
  113599. "D": [ 4542 ],
  113600. "E": [ 3995 ],
  113601. "Q": [ 4925 ]
  113602. }
  113603. },
  113604. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_5": {
  113605. "hide_name": 0,
  113606. "type": "SB_DFFE",
  113607. "parameters": {
  113608. },
  113609. "attributes": {
  113610. "module_not_derived": "00000000000000000000000000000001",
  113611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113612. },
  113613. "port_directions": {
  113614. "C": "input",
  113615. "D": "input",
  113616. "E": "input",
  113617. "Q": "output"
  113618. },
  113619. "connections": {
  113620. "C": [ 42 ],
  113621. "D": [ 4538 ],
  113622. "E": [ 3995 ],
  113623. "Q": [ 4926 ]
  113624. }
  113625. },
  113626. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_6": {
  113627. "hide_name": 0,
  113628. "type": "SB_DFFE",
  113629. "parameters": {
  113630. },
  113631. "attributes": {
  113632. "module_not_derived": "00000000000000000000000000000001",
  113633. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113634. },
  113635. "port_directions": {
  113636. "C": "input",
  113637. "D": "input",
  113638. "E": "input",
  113639. "Q": "output"
  113640. },
  113641. "connections": {
  113642. "C": [ 42 ],
  113643. "D": [ 4468 ],
  113644. "E": [ 3995 ],
  113645. "Q": [ 4927 ]
  113646. }
  113647. },
  113648. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_7": {
  113649. "hide_name": 0,
  113650. "type": "SB_DFFE",
  113651. "parameters": {
  113652. },
  113653. "attributes": {
  113654. "module_not_derived": "00000000000000000000000000000001",
  113655. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113656. },
  113657. "port_directions": {
  113658. "C": "input",
  113659. "D": "input",
  113660. "E": "input",
  113661. "Q": "output"
  113662. },
  113663. "connections": {
  113664. "C": [ 42 ],
  113665. "D": [ 4512 ],
  113666. "E": [ 3995 ],
  113667. "Q": [ 4928 ]
  113668. }
  113669. },
  113670. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_8": {
  113671. "hide_name": 0,
  113672. "type": "SB_DFFE",
  113673. "parameters": {
  113674. },
  113675. "attributes": {
  113676. "module_not_derived": "00000000000000000000000000000001",
  113677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113678. },
  113679. "port_directions": {
  113680. "C": "input",
  113681. "D": "input",
  113682. "E": "input",
  113683. "Q": "output"
  113684. },
  113685. "connections": {
  113686. "C": [ 42 ],
  113687. "D": [ 4505 ],
  113688. "E": [ 3995 ],
  113689. "Q": [ 4929 ]
  113690. }
  113691. },
  113692. "cpu_I.execute_to_memory_MUL_HH_SB_DFFE_Q_9": {
  113693. "hide_name": 0,
  113694. "type": "SB_DFFE",
  113695. "parameters": {
  113696. },
  113697. "attributes": {
  113698. "module_not_derived": "00000000000000000000000000000001",
  113699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113700. },
  113701. "port_directions": {
  113702. "C": "input",
  113703. "D": "input",
  113704. "E": "input",
  113705. "Q": "output"
  113706. },
  113707. "connections": {
  113708. "C": [ 42 ],
  113709. "D": [ 4498 ],
  113710. "E": [ 3995 ],
  113711. "Q": [ 4930 ]
  113712. }
  113713. },
  113714. "cpu_I.execute_to_memory_MUL_HH_SB_MAC16_O": {
  113715. "hide_name": 0,
  113716. "type": "SB_MAC16",
  113717. "parameters": {
  113718. "A_REG": "1",
  113719. "A_SIGNED": "00000000000000000000000000000000",
  113720. "BOTADDSUB_CARRYSELECT": "00",
  113721. "BOTADDSUB_LOWERINPUT": "10",
  113722. "BOTADDSUB_UPPERINPUT": "1",
  113723. "BOTOUTPUT_SELECT": "01",
  113724. "BOT_8x8_MULT_REG": "0",
  113725. "B_REG": "1",
  113726. "B_SIGNED": "00000000000000000000000000000000",
  113727. "C_REG": "0",
  113728. "D_REG": "0",
  113729. "MODE_8x8": "0",
  113730. "NEG_TRIGGER": "0",
  113731. "PIPELINE_16x16_MULT_REG1": "0",
  113732. "PIPELINE_16x16_MULT_REG2": "0",
  113733. "TOPADDSUB_CARRYSELECT": "11",
  113734. "TOPADDSUB_LOWERINPUT": "10",
  113735. "TOPADDSUB_UPPERINPUT": "1",
  113736. "TOPOUTPUT_SELECT": "11",
  113737. "TOP_8x8_MULT_REG": "0"
  113738. },
  113739. "attributes": {
  113740. "module_not_derived": "00000000000000000000000000000001",
  113741. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2499.28-2499.95|/usr/bin/../share/yosys/mul2dsp.v:148.7-152.6|/usr/bin/../share/yosys/mul2dsp.v:205.7-209.6|/usr/bin/../share/yosys/mul2dsp.v:253.6-257.5|/usr/bin/../share/yosys/ice40/dsp_map.v:29.4-33.3"
  113742. },
  113743. "port_directions": {
  113744. "A": "input",
  113745. "ACCUMCI": "input",
  113746. "ACCUMCO": "output",
  113747. "ADDSUBBOT": "input",
  113748. "ADDSUBTOP": "input",
  113749. "AHOLD": "input",
  113750. "B": "input",
  113751. "BHOLD": "input",
  113752. "C": "input",
  113753. "CE": "input",
  113754. "CHOLD": "input",
  113755. "CI": "input",
  113756. "CLK": "input",
  113757. "CO": "output",
  113758. "D": "input",
  113759. "DHOLD": "input",
  113760. "IRSTBOT": "input",
  113761. "IRSTTOP": "input",
  113762. "O": "output",
  113763. "OHOLDBOT": "input",
  113764. "OHOLDTOP": "input",
  113765. "OLOADBOT": "input",
  113766. "OLOADTOP": "input",
  113767. "ORSTBOT": "input",
  113768. "ORSTTOP": "input",
  113769. "SIGNEXTIN": "input",
  113770. "SIGNEXTOUT": "output"
  113771. },
  113772. "connections": {
  113773. "A": [ 3777, 3774, 3771, 3766, 3756, 3748, 3743, 3738, 3735, 3732, 3729, 3726, 3723, 3720, 3837, 3832 ],
  113774. "ACCUMCI": [ "x" ],
  113775. "ACCUMCO": [ 4931 ],
  113776. "ADDSUBBOT": [ "0" ],
  113777. "ADDSUBTOP": [ "0" ],
  113778. "AHOLD": [ 1020 ],
  113779. "B": [ 3911, 3906, 3901, 3898, 3892, 3884, 3881, 3878, 3873, 3868, 3866, 3861, 3856, 3851, 3959, 3956 ],
  113780. "BHOLD": [ 1020 ],
  113781. "C": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  113782. "CE": [ "1" ],
  113783. "CHOLD": [ "0" ],
  113784. "CI": [ "x" ],
  113785. "CLK": [ 42 ],
  113786. "CO": [ 4932 ],
  113787. "D": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  113788. "DHOLD": [ "0" ],
  113789. "IRSTBOT": [ "0" ],
  113790. "IRSTTOP": [ "0" ],
  113791. "O": [ 4933, 4934, 4935, 4936, 4937, 4938, 4939, 4940, 4941, 4942, 4943, 4944, 4945, 4946, 4947, 4948, 4516, 4558, 4563, 4473, 4476, 4490, 4499, 4506, 4513, 4616, 4619, 4622, 4625, 4628, 4569, 4565 ],
  113792. "OHOLDBOT": [ 1018 ],
  113793. "OHOLDTOP": [ 1018 ],
  113794. "OLOADBOT": [ "0" ],
  113795. "OLOADTOP": [ "0" ],
  113796. "ORSTBOT": [ "0" ],
  113797. "ORSTTOP": [ "0" ],
  113798. "SIGNEXTIN": [ "x" ],
  113799. "SIGNEXTOUT": [ 4949 ]
  113800. }
  113801. },
  113802. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q": {
  113803. "hide_name": 0,
  113804. "type": "SB_DFFE",
  113805. "parameters": {
  113806. },
  113807. "attributes": {
  113808. "module_not_derived": "00000000000000000000000000000001",
  113809. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113810. },
  113811. "port_directions": {
  113812. "C": "input",
  113813. "D": "input",
  113814. "E": "input",
  113815. "Q": "output"
  113816. },
  113817. "connections": {
  113818. "C": [ 42 ],
  113819. "D": [ 4631 ],
  113820. "E": [ 3995 ],
  113821. "Q": [ 4950 ]
  113822. }
  113823. },
  113824. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_1": {
  113825. "hide_name": 0,
  113826. "type": "SB_DFFE",
  113827. "parameters": {
  113828. },
  113829. "attributes": {
  113830. "module_not_derived": "00000000000000000000000000000001",
  113831. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113832. },
  113833. "port_directions": {
  113834. "C": "input",
  113835. "D": "input",
  113836. "E": "input",
  113837. "Q": "output"
  113838. },
  113839. "connections": {
  113840. "C": [ 42 ],
  113841. "D": [ 4631 ],
  113842. "E": [ 3995 ],
  113843. "Q": [ 4951 ]
  113844. }
  113845. },
  113846. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_10": {
  113847. "hide_name": 0,
  113848. "type": "SB_DFFE",
  113849. "parameters": {
  113850. },
  113851. "attributes": {
  113852. "module_not_derived": "00000000000000000000000000000001",
  113853. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113854. },
  113855. "port_directions": {
  113856. "C": "input",
  113857. "D": "input",
  113858. "E": "input",
  113859. "Q": "output"
  113860. },
  113861. "connections": {
  113862. "C": [ 42 ],
  113863. "D": [ 4661 ],
  113864. "E": [ 3995 ],
  113865. "Q": [ 4952 ]
  113866. }
  113867. },
  113868. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_11": {
  113869. "hide_name": 0,
  113870. "type": "SB_DFFE",
  113871. "parameters": {
  113872. },
  113873. "attributes": {
  113874. "module_not_derived": "00000000000000000000000000000001",
  113875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113876. },
  113877. "port_directions": {
  113878. "C": "input",
  113879. "D": "input",
  113880. "E": "input",
  113881. "Q": "output"
  113882. },
  113883. "connections": {
  113884. "C": [ 42 ],
  113885. "D": [ 4635 ],
  113886. "E": [ 3995 ],
  113887. "Q": [ 4953 ]
  113888. }
  113889. },
  113890. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_12": {
  113891. "hide_name": 0,
  113892. "type": "SB_DFFE",
  113893. "parameters": {
  113894. },
  113895. "attributes": {
  113896. "module_not_derived": "00000000000000000000000000000001",
  113897. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113898. },
  113899. "port_directions": {
  113900. "C": "input",
  113901. "D": "input",
  113902. "E": "input",
  113903. "Q": "output"
  113904. },
  113905. "connections": {
  113906. "C": [ 42 ],
  113907. "D": [ 4657 ],
  113908. "E": [ 3995 ],
  113909. "Q": [ 4954 ]
  113910. }
  113911. },
  113912. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_13": {
  113913. "hide_name": 0,
  113914. "type": "SB_DFFE",
  113915. "parameters": {
  113916. },
  113917. "attributes": {
  113918. "module_not_derived": "00000000000000000000000000000001",
  113919. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113920. },
  113921. "port_directions": {
  113922. "C": "input",
  113923. "D": "input",
  113924. "E": "input",
  113925. "Q": "output"
  113926. },
  113927. "connections": {
  113928. "C": [ 42 ],
  113929. "D": [ 4653 ],
  113930. "E": [ 3995 ],
  113931. "Q": [ 4955 ]
  113932. }
  113933. },
  113934. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_14": {
  113935. "hide_name": 0,
  113936. "type": "SB_DFFE",
  113937. "parameters": {
  113938. },
  113939. "attributes": {
  113940. "module_not_derived": "00000000000000000000000000000001",
  113941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113942. },
  113943. "port_directions": {
  113944. "C": "input",
  113945. "D": "input",
  113946. "E": "input",
  113947. "Q": "output"
  113948. },
  113949. "connections": {
  113950. "C": [ 42 ],
  113951. "D": [ 4649 ],
  113952. "E": [ 3995 ],
  113953. "Q": [ 4956 ]
  113954. }
  113955. },
  113956. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_15": {
  113957. "hide_name": 0,
  113958. "type": "SB_DFFE",
  113959. "parameters": {
  113960. },
  113961. "attributes": {
  113962. "module_not_derived": "00000000000000000000000000000001",
  113963. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113964. },
  113965. "port_directions": {
  113966. "C": "input",
  113967. "D": "input",
  113968. "E": "input",
  113969. "Q": "output"
  113970. },
  113971. "connections": {
  113972. "C": [ 42 ],
  113973. "D": [ 4645 ],
  113974. "E": [ 3995 ],
  113975. "Q": [ 4957 ]
  113976. }
  113977. },
  113978. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_16": {
  113979. "hide_name": 0,
  113980. "type": "SB_DFFE",
  113981. "parameters": {
  113982. },
  113983. "attributes": {
  113984. "module_not_derived": "00000000000000000000000000000001",
  113985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  113986. },
  113987. "port_directions": {
  113988. "C": "input",
  113989. "D": "input",
  113990. "E": "input",
  113991. "Q": "output"
  113992. },
  113993. "connections": {
  113994. "C": [ 42 ],
  113995. "D": [ 4639 ],
  113996. "E": [ 3995 ],
  113997. "Q": [ 4958 ]
  113998. }
  113999. },
  114000. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_17": {
  114001. "hide_name": 0,
  114002. "type": "SB_DFFE",
  114003. "parameters": {
  114004. },
  114005. "attributes": {
  114006. "module_not_derived": "00000000000000000000000000000001",
  114007. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114008. },
  114009. "port_directions": {
  114010. "C": "input",
  114011. "D": "input",
  114012. "E": "input",
  114013. "Q": "output"
  114014. },
  114015. "connections": {
  114016. "C": [ 42 ],
  114017. "D": [ 4694 ],
  114018. "E": [ 3995 ],
  114019. "Q": [ 4959 ]
  114020. }
  114021. },
  114022. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_2": {
  114023. "hide_name": 0,
  114024. "type": "SB_DFFE",
  114025. "parameters": {
  114026. },
  114027. "attributes": {
  114028. "module_not_derived": "00000000000000000000000000000001",
  114029. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114030. },
  114031. "port_directions": {
  114032. "C": "input",
  114033. "D": "input",
  114034. "E": "input",
  114035. "Q": "output"
  114036. },
  114037. "connections": {
  114038. "C": [ 42 ],
  114039. "D": [ 4693 ],
  114040. "E": [ 3995 ],
  114041. "Q": [ 4960 ]
  114042. }
  114043. },
  114044. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_3": {
  114045. "hide_name": 0,
  114046. "type": "SB_DFFE",
  114047. "parameters": {
  114048. },
  114049. "attributes": {
  114050. "module_not_derived": "00000000000000000000000000000001",
  114051. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114052. },
  114053. "port_directions": {
  114054. "C": "input",
  114055. "D": "input",
  114056. "E": "input",
  114057. "Q": "output"
  114058. },
  114059. "connections": {
  114060. "C": [ 42 ],
  114061. "D": [ 4689 ],
  114062. "E": [ 3995 ],
  114063. "Q": [ 4961 ]
  114064. }
  114065. },
  114066. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_4": {
  114067. "hide_name": 0,
  114068. "type": "SB_DFFE",
  114069. "parameters": {
  114070. },
  114071. "attributes": {
  114072. "module_not_derived": "00000000000000000000000000000001",
  114073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114074. },
  114075. "port_directions": {
  114076. "C": "input",
  114077. "D": "input",
  114078. "E": "input",
  114079. "Q": "output"
  114080. },
  114081. "connections": {
  114082. "C": [ 42 ],
  114083. "D": [ 4685 ],
  114084. "E": [ 3995 ],
  114085. "Q": [ 4962 ]
  114086. }
  114087. },
  114088. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_5": {
  114089. "hide_name": 0,
  114090. "type": "SB_DFFE",
  114091. "parameters": {
  114092. },
  114093. "attributes": {
  114094. "module_not_derived": "00000000000000000000000000000001",
  114095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114096. },
  114097. "port_directions": {
  114098. "C": "input",
  114099. "D": "input",
  114100. "E": "input",
  114101. "Q": "output"
  114102. },
  114103. "connections": {
  114104. "C": [ 42 ],
  114105. "D": [ 4681 ],
  114106. "E": [ 3995 ],
  114107. "Q": [ 4963 ]
  114108. }
  114109. },
  114110. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_6": {
  114111. "hide_name": 0,
  114112. "type": "SB_DFFE",
  114113. "parameters": {
  114114. },
  114115. "attributes": {
  114116. "module_not_derived": "00000000000000000000000000000001",
  114117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114118. },
  114119. "port_directions": {
  114120. "C": "input",
  114121. "D": "input",
  114122. "E": "input",
  114123. "Q": "output"
  114124. },
  114125. "connections": {
  114126. "C": [ 42 ],
  114127. "D": [ 4677 ],
  114128. "E": [ 3995 ],
  114129. "Q": [ 4964 ]
  114130. }
  114131. },
  114132. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_7": {
  114133. "hide_name": 0,
  114134. "type": "SB_DFFE",
  114135. "parameters": {
  114136. },
  114137. "attributes": {
  114138. "module_not_derived": "00000000000000000000000000000001",
  114139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114140. },
  114141. "port_directions": {
  114142. "C": "input",
  114143. "D": "input",
  114144. "E": "input",
  114145. "Q": "output"
  114146. },
  114147. "connections": {
  114148. "C": [ 42 ],
  114149. "D": [ 4673 ],
  114150. "E": [ 3995 ],
  114151. "Q": [ 4965 ]
  114152. }
  114153. },
  114154. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_8": {
  114155. "hide_name": 0,
  114156. "type": "SB_DFFE",
  114157. "parameters": {
  114158. },
  114159. "attributes": {
  114160. "module_not_derived": "00000000000000000000000000000001",
  114161. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114162. },
  114163. "port_directions": {
  114164. "C": "input",
  114165. "D": "input",
  114166. "E": "input",
  114167. "Q": "output"
  114168. },
  114169. "connections": {
  114170. "C": [ 42 ],
  114171. "D": [ 4669 ],
  114172. "E": [ 3995 ],
  114173. "Q": [ 4966 ]
  114174. }
  114175. },
  114176. "cpu_I.execute_to_memory_MUL_HL_SB_DFFE_Q_9": {
  114177. "hide_name": 0,
  114178. "type": "SB_DFFE",
  114179. "parameters": {
  114180. },
  114181. "attributes": {
  114182. "module_not_derived": "00000000000000000000000000000001",
  114183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114184. },
  114185. "port_directions": {
  114186. "C": "input",
  114187. "D": "input",
  114188. "E": "input",
  114189. "Q": "output"
  114190. },
  114191. "connections": {
  114192. "C": [ 42 ],
  114193. "D": [ 4665 ],
  114194. "E": [ 3995 ],
  114195. "Q": [ 4967 ]
  114196. }
  114197. },
  114198. "cpu_I.execute_to_memory_MUL_HL_SB_MAC16_O": {
  114199. "hide_name": 0,
  114200. "type": "SB_MAC16",
  114201. "parameters": {
  114202. "A_REG": "1",
  114203. "A_SIGNED": "00000000000000000000000000000000",
  114204. "BOTADDSUB_CARRYSELECT": "00",
  114205. "BOTADDSUB_LOWERINPUT": "10",
  114206. "BOTADDSUB_UPPERINPUT": "1",
  114207. "BOTOUTPUT_SELECT": "01",
  114208. "BOT_8x8_MULT_REG": "0",
  114209. "B_REG": "1",
  114210. "B_SIGNED": "00000000000000000000000000000000",
  114211. "C_REG": "0",
  114212. "D_REG": "0",
  114213. "MODE_8x8": "0",
  114214. "NEG_TRIGGER": "0",
  114215. "PIPELINE_16x16_MULT_REG1": "0",
  114216. "PIPELINE_16x16_MULT_REG2": "0",
  114217. "TOPADDSUB_CARRYSELECT": "11",
  114218. "TOPADDSUB_LOWERINPUT": "10",
  114219. "TOPADDSUB_UPPERINPUT": "1",
  114220. "TOPOUTPUT_SELECT": "11",
  114221. "TOP_8x8_MULT_REG": "0"
  114222. },
  114223. "attributes": {
  114224. "module_not_derived": "00000000000000000000000000000001",
  114225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2477.28-2477.95|/usr/bin/../share/yosys/mul2dsp.v:148.7-152.6|/usr/bin/../share/yosys/mul2dsp.v:205.7-209.6|/usr/bin/../share/yosys/mul2dsp.v:253.6-257.5|/usr/bin/../share/yosys/ice40/dsp_map.v:29.4-33.3"
  114226. },
  114227. "port_directions": {
  114228. "A": "input",
  114229. "ACCUMCI": "input",
  114230. "ACCUMCO": "output",
  114231. "ADDSUBBOT": "input",
  114232. "ADDSUBTOP": "input",
  114233. "AHOLD": "input",
  114234. "B": "input",
  114235. "BHOLD": "input",
  114236. "C": "input",
  114237. "CE": "input",
  114238. "CHOLD": "input",
  114239. "CI": "input",
  114240. "CLK": "input",
  114241. "CO": "output",
  114242. "D": "input",
  114243. "DHOLD": "input",
  114244. "IRSTBOT": "input",
  114245. "IRSTTOP": "input",
  114246. "O": "output",
  114247. "OHOLDBOT": "input",
  114248. "OHOLDTOP": "input",
  114249. "OLOADBOT": "input",
  114250. "OLOADTOP": "input",
  114251. "ORSTBOT": "input",
  114252. "ORSTTOP": "input",
  114253. "SIGNEXTIN": "input",
  114254. "SIGNEXTOUT": "output"
  114255. },
  114256. "connections": {
  114257. "A": [ 3777, 3774, 3771, 3766, 3756, 3748, 3743, 3738, 3735, 3732, 3729, 3726, 3723, 3720, 3837, 3832 ],
  114258. "ACCUMCI": [ "x" ],
  114259. "ACCUMCO": [ 4968 ],
  114260. "ADDSUBBOT": [ "0" ],
  114261. "ADDSUBTOP": [ "0" ],
  114262. "AHOLD": [ 1020 ],
  114263. "B": [ 3843, 3895, 3847, 3953, 3950, 3947, 3944, 3933, 3890, 3845, 3938, 3935, 3925, 3922, 3919, 3914 ],
  114264. "BHOLD": [ 1020 ],
  114265. "C": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  114266. "CE": [ "1" ],
  114267. "CHOLD": [ "0" ],
  114268. "CI": [ "x" ],
  114269. "CLK": [ 42 ],
  114270. "CO": [ 4969 ],
  114271. "D": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  114272. "DHOLD": [ "0" ],
  114273. "IRSTBOT": [ "0" ],
  114274. "IRSTTOP": [ "0" ],
  114275. "O": [ 4970, 4971, 4972, 4973, 4974, 4975, 4976, 4977, 4978, 4979, 4980, 4981, 4982, 4983, 4984, 4985, 4641, 4636, 4642, 4646, 4650, 4654, 4632, 4658, 4662, 4666, 4670, 4674, 4678, 4682, 4686, 4690 ],
  114276. "OHOLDBOT": [ 1018 ],
  114277. "OHOLDTOP": [ 1018 ],
  114278. "OLOADBOT": [ "0" ],
  114279. "OLOADTOP": [ "0" ],
  114280. "ORSTBOT": [ "0" ],
  114281. "ORSTTOP": [ "0" ],
  114282. "SIGNEXTIN": [ "x" ],
  114283. "SIGNEXTOUT": [ 4986 ]
  114284. }
  114285. },
  114286. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q": {
  114287. "hide_name": 0,
  114288. "type": "SB_DFFE",
  114289. "parameters": {
  114290. },
  114291. "attributes": {
  114292. "module_not_derived": "00000000000000000000000000000001",
  114293. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114294. },
  114295. "port_directions": {
  114296. "C": "input",
  114297. "D": "input",
  114298. "E": "input",
  114299. "Q": "output"
  114300. },
  114301. "connections": {
  114302. "C": [ 42 ],
  114303. "D": [ 4696 ],
  114304. "E": [ 3995 ],
  114305. "Q": [ 4987 ]
  114306. }
  114307. },
  114308. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_1": {
  114309. "hide_name": 0,
  114310. "type": "SB_DFFE",
  114311. "parameters": {
  114312. },
  114313. "attributes": {
  114314. "module_not_derived": "00000000000000000000000000000001",
  114315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114316. },
  114317. "port_directions": {
  114318. "C": "input",
  114319. "D": "input",
  114320. "E": "input",
  114321. "Q": "output"
  114322. },
  114323. "connections": {
  114324. "C": [ 42 ],
  114325. "D": [ 4755 ],
  114326. "E": [ 3995 ],
  114327. "Q": [ 4988 ]
  114328. }
  114329. },
  114330. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_10": {
  114331. "hide_name": 0,
  114332. "type": "SB_DFFE",
  114333. "parameters": {
  114334. },
  114335. "attributes": {
  114336. "module_not_derived": "00000000000000000000000000000001",
  114337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114338. },
  114339. "port_directions": {
  114340. "C": "input",
  114341. "D": "input",
  114342. "E": "input",
  114343. "Q": "output"
  114344. },
  114345. "connections": {
  114346. "C": [ 42 ],
  114347. "D": [ 4723 ],
  114348. "E": [ 3995 ],
  114349. "Q": [ 4989 ]
  114350. }
  114351. },
  114352. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_11": {
  114353. "hide_name": 0,
  114354. "type": "SB_DFFE",
  114355. "parameters": {
  114356. },
  114357. "attributes": {
  114358. "module_not_derived": "00000000000000000000000000000001",
  114359. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114360. },
  114361. "port_directions": {
  114362. "C": "input",
  114363. "D": "input",
  114364. "E": "input",
  114365. "Q": "output"
  114366. },
  114367. "connections": {
  114368. "C": [ 42 ],
  114369. "D": [ 4719 ],
  114370. "E": [ 3995 ],
  114371. "Q": [ 4990 ]
  114372. }
  114373. },
  114374. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_12": {
  114375. "hide_name": 0,
  114376. "type": "SB_DFFE",
  114377. "parameters": {
  114378. },
  114379. "attributes": {
  114380. "module_not_derived": "00000000000000000000000000000001",
  114381. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114382. },
  114383. "port_directions": {
  114384. "C": "input",
  114385. "D": "input",
  114386. "E": "input",
  114387. "Q": "output"
  114388. },
  114389. "connections": {
  114390. "C": [ 42 ],
  114391. "D": [ 4715 ],
  114392. "E": [ 3995 ],
  114393. "Q": [ 4991 ]
  114394. }
  114395. },
  114396. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_13": {
  114397. "hide_name": 0,
  114398. "type": "SB_DFFE",
  114399. "parameters": {
  114400. },
  114401. "attributes": {
  114402. "module_not_derived": "00000000000000000000000000000001",
  114403. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114404. },
  114405. "port_directions": {
  114406. "C": "input",
  114407. "D": "input",
  114408. "E": "input",
  114409. "Q": "output"
  114410. },
  114411. "connections": {
  114412. "C": [ 42 ],
  114413. "D": [ 4711 ],
  114414. "E": [ 3995 ],
  114415. "Q": [ 4992 ]
  114416. }
  114417. },
  114418. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_14": {
  114419. "hide_name": 0,
  114420. "type": "SB_DFFE",
  114421. "parameters": {
  114422. },
  114423. "attributes": {
  114424. "module_not_derived": "00000000000000000000000000000001",
  114425. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114426. },
  114427. "port_directions": {
  114428. "C": "input",
  114429. "D": "input",
  114430. "E": "input",
  114431. "Q": "output"
  114432. },
  114433. "connections": {
  114434. "C": [ 42 ],
  114435. "D": [ 4704 ],
  114436. "E": [ 3995 ],
  114437. "Q": [ 4993 ]
  114438. }
  114439. },
  114440. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_15": {
  114441. "hide_name": 0,
  114442. "type": "SB_DFFE",
  114443. "parameters": {
  114444. },
  114445. "attributes": {
  114446. "module_not_derived": "00000000000000000000000000000001",
  114447. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114448. },
  114449. "port_directions": {
  114450. "C": "input",
  114451. "D": "input",
  114452. "E": "input",
  114453. "Q": "output"
  114454. },
  114455. "connections": {
  114456. "C": [ 42 ],
  114457. "D": [ 4759 ],
  114458. "E": [ 3995 ],
  114459. "Q": [ 4994 ]
  114460. }
  114461. },
  114462. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_16": {
  114463. "hide_name": 0,
  114464. "type": "SB_DFFE",
  114465. "parameters": {
  114466. },
  114467. "attributes": {
  114468. "module_not_derived": "00000000000000000000000000000001",
  114469. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114470. },
  114471. "port_directions": {
  114472. "C": "input",
  114473. "D": "input",
  114474. "E": "input",
  114475. "Q": "output"
  114476. },
  114477. "connections": {
  114478. "C": [ 42 ],
  114479. "D": [ 4758 ],
  114480. "E": [ 3995 ],
  114481. "Q": [ 4995 ]
  114482. }
  114483. },
  114484. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_2": {
  114485. "hide_name": 0,
  114486. "type": "SB_DFFE",
  114487. "parameters": {
  114488. },
  114489. "attributes": {
  114490. "module_not_derived": "00000000000000000000000000000001",
  114491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114492. },
  114493. "port_directions": {
  114494. "C": "input",
  114495. "D": "input",
  114496. "E": "input",
  114497. "Q": "output"
  114498. },
  114499. "connections": {
  114500. "C": [ 42 ],
  114501. "D": [ 4751 ],
  114502. "E": [ 3995 ],
  114503. "Q": [ 4996 ]
  114504. }
  114505. },
  114506. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_3": {
  114507. "hide_name": 0,
  114508. "type": "SB_DFFE",
  114509. "parameters": {
  114510. },
  114511. "attributes": {
  114512. "module_not_derived": "00000000000000000000000000000001",
  114513. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114514. },
  114515. "port_directions": {
  114516. "C": "input",
  114517. "D": "input",
  114518. "E": "input",
  114519. "Q": "output"
  114520. },
  114521. "connections": {
  114522. "C": [ 42 ],
  114523. "D": [ 4747 ],
  114524. "E": [ 3995 ],
  114525. "Q": [ 4997 ]
  114526. }
  114527. },
  114528. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_4": {
  114529. "hide_name": 0,
  114530. "type": "SB_DFFE",
  114531. "parameters": {
  114532. },
  114533. "attributes": {
  114534. "module_not_derived": "00000000000000000000000000000001",
  114535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114536. },
  114537. "port_directions": {
  114538. "C": "input",
  114539. "D": "input",
  114540. "E": "input",
  114541. "Q": "output"
  114542. },
  114543. "connections": {
  114544. "C": [ 42 ],
  114545. "D": [ 4743 ],
  114546. "E": [ 3995 ],
  114547. "Q": [ 4998 ]
  114548. }
  114549. },
  114550. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_5": {
  114551. "hide_name": 0,
  114552. "type": "SB_DFFE",
  114553. "parameters": {
  114554. },
  114555. "attributes": {
  114556. "module_not_derived": "00000000000000000000000000000001",
  114557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114558. },
  114559. "port_directions": {
  114560. "C": "input",
  114561. "D": "input",
  114562. "E": "input",
  114563. "Q": "output"
  114564. },
  114565. "connections": {
  114566. "C": [ 42 ],
  114567. "D": [ 4739 ],
  114568. "E": [ 3995 ],
  114569. "Q": [ 4999 ]
  114570. }
  114571. },
  114572. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_6": {
  114573. "hide_name": 0,
  114574. "type": "SB_DFFE",
  114575. "parameters": {
  114576. },
  114577. "attributes": {
  114578. "module_not_derived": "00000000000000000000000000000001",
  114579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114580. },
  114581. "port_directions": {
  114582. "C": "input",
  114583. "D": "input",
  114584. "E": "input",
  114585. "Q": "output"
  114586. },
  114587. "connections": {
  114588. "C": [ 42 ],
  114589. "D": [ 4735 ],
  114590. "E": [ 3995 ],
  114591. "Q": [ 5000 ]
  114592. }
  114593. },
  114594. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_7": {
  114595. "hide_name": 0,
  114596. "type": "SB_DFFE",
  114597. "parameters": {
  114598. },
  114599. "attributes": {
  114600. "module_not_derived": "00000000000000000000000000000001",
  114601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114602. },
  114603. "port_directions": {
  114604. "C": "input",
  114605. "D": "input",
  114606. "E": "input",
  114607. "Q": "output"
  114608. },
  114609. "connections": {
  114610. "C": [ 42 ],
  114611. "D": [ 4700 ],
  114612. "E": [ 3995 ],
  114613. "Q": [ 5001 ]
  114614. }
  114615. },
  114616. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_8": {
  114617. "hide_name": 0,
  114618. "type": "SB_DFFE",
  114619. "parameters": {
  114620. },
  114621. "attributes": {
  114622. "module_not_derived": "00000000000000000000000000000001",
  114623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114624. },
  114625. "port_directions": {
  114626. "C": "input",
  114627. "D": "input",
  114628. "E": "input",
  114629. "Q": "output"
  114630. },
  114631. "connections": {
  114632. "C": [ 42 ],
  114633. "D": [ 4731 ],
  114634. "E": [ 3995 ],
  114635. "Q": [ 5002 ]
  114636. }
  114637. },
  114638. "cpu_I.execute_to_memory_MUL_LH_SB_DFFE_Q_9": {
  114639. "hide_name": 0,
  114640. "type": "SB_DFFE",
  114641. "parameters": {
  114642. },
  114643. "attributes": {
  114644. "module_not_derived": "00000000000000000000000000000001",
  114645. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114646. },
  114647. "port_directions": {
  114648. "C": "input",
  114649. "D": "input",
  114650. "E": "input",
  114651. "Q": "output"
  114652. },
  114653. "connections": {
  114654. "C": [ 42 ],
  114655. "D": [ 4727 ],
  114656. "E": [ 3995 ],
  114657. "Q": [ 5003 ]
  114658. }
  114659. },
  114660. "cpu_I.execute_to_memory_MUL_LH_SB_MAC16_O": {
  114661. "hide_name": 0,
  114662. "type": "SB_MAC16",
  114663. "parameters": {
  114664. "A_REG": "1",
  114665. "A_SIGNED": "00000000000000000000000000000000",
  114666. "BOTADDSUB_CARRYSELECT": "00",
  114667. "BOTADDSUB_LOWERINPUT": "10",
  114668. "BOTADDSUB_UPPERINPUT": "1",
  114669. "BOTOUTPUT_SELECT": "01",
  114670. "BOT_8x8_MULT_REG": "0",
  114671. "B_REG": "1",
  114672. "B_SIGNED": "00000000000000000000000000000000",
  114673. "C_REG": "0",
  114674. "D_REG": "0",
  114675. "MODE_8x8": "0",
  114676. "NEG_TRIGGER": "0",
  114677. "PIPELINE_16x16_MULT_REG1": "0",
  114678. "PIPELINE_16x16_MULT_REG2": "0",
  114679. "TOPADDSUB_CARRYSELECT": "11",
  114680. "TOPADDSUB_LOWERINPUT": "10",
  114681. "TOPADDSUB_UPPERINPUT": "1",
  114682. "TOPOUTPUT_SELECT": "11",
  114683. "TOP_8x8_MULT_REG": "0"
  114684. },
  114685. "attributes": {
  114686. "module_not_derived": "00000000000000000000000000000001",
  114687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2451.28-2451.95|/usr/bin/../share/yosys/mul2dsp.v:148.7-152.6|/usr/bin/../share/yosys/mul2dsp.v:205.7-209.6|/usr/bin/../share/yosys/mul2dsp.v:253.6-257.5|/usr/bin/../share/yosys/ice40/dsp_map.v:29.4-33.3"
  114688. },
  114689. "port_directions": {
  114690. "A": "input",
  114691. "ACCUMCI": "input",
  114692. "ACCUMCO": "output",
  114693. "ADDSUBBOT": "input",
  114694. "ADDSUBTOP": "input",
  114695. "AHOLD": "input",
  114696. "B": "input",
  114697. "BHOLD": "input",
  114698. "C": "input",
  114699. "CE": "input",
  114700. "CHOLD": "input",
  114701. "CI": "input",
  114702. "CLK": "input",
  114703. "CO": "output",
  114704. "D": "input",
  114705. "DHOLD": "input",
  114706. "IRSTBOT": "input",
  114707. "IRSTTOP": "input",
  114708. "O": "output",
  114709. "OHOLDBOT": "input",
  114710. "OHOLDTOP": "input",
  114711. "OLOADBOT": "input",
  114712. "OLOADTOP": "input",
  114713. "ORSTBOT": "input",
  114714. "ORSTTOP": "input",
  114715. "SIGNEXTIN": "input",
  114716. "SIGNEXTOUT": "output"
  114717. },
  114718. "connections": {
  114719. "A": [ 3710, 3761, 3714, 3827, 3822, 3817, 3812, 3799, 3754, 3712, 3806, 3801, 3795, 3790, 3785, 3782 ],
  114720. "ACCUMCI": [ "x" ],
  114721. "ACCUMCO": [ 5004 ],
  114722. "ADDSUBBOT": [ "0" ],
  114723. "ADDSUBTOP": [ "0" ],
  114724. "AHOLD": [ 1020 ],
  114725. "B": [ 3911, 3906, 3901, 3898, 3892, 3884, 3881, 3878, 3873, 3868, 3866, 3861, 3856, 3851, 3959, 3956 ],
  114726. "BHOLD": [ 1020 ],
  114727. "C": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  114728. "CE": [ "1" ],
  114729. "CHOLD": [ "0" ],
  114730. "CI": [ "x" ],
  114731. "CLK": [ 42 ],
  114732. "CO": [ 5005 ],
  114733. "D": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  114734. "DHOLD": [ "0" ],
  114735. "IRSTBOT": [ "0" ],
  114736. "IRSTTOP": [ "0" ],
  114737. "O": [ 5006, 5007, 5008, 5009, 5010, 5011, 5012, 5013, 5014, 5015, 5016, 5017, 5018, 5019, 5020, 5021, 4756, 4706, 4701, 4708, 4712, 4716, 4720, 4724, 4728, 4697, 4732, 4736, 4740, 4744, 4748, 4752 ],
  114738. "OHOLDBOT": [ 1018 ],
  114739. "OHOLDTOP": [ 1018 ],
  114740. "OLOADBOT": [ "0" ],
  114741. "OLOADTOP": [ "0" ],
  114742. "ORSTBOT": [ "0" ],
  114743. "ORSTTOP": [ "0" ],
  114744. "SIGNEXTIN": [ "x" ],
  114745. "SIGNEXTOUT": [ 5022 ]
  114746. }
  114747. },
  114748. "cpu_I.execute_to_memory_MUL_LL_SB_MAC16_O": {
  114749. "hide_name": 0,
  114750. "type": "SB_MAC16",
  114751. "parameters": {
  114752. "A_REG": "1",
  114753. "A_SIGNED": "00000000000000000000000000000000",
  114754. "BOTADDSUB_CARRYSELECT": "00",
  114755. "BOTADDSUB_LOWERINPUT": "10",
  114756. "BOTADDSUB_UPPERINPUT": "1",
  114757. "BOTOUTPUT_SELECT": "01",
  114758. "BOT_8x8_MULT_REG": "0",
  114759. "B_REG": "1",
  114760. "B_SIGNED": "00000000000000000000000000000000",
  114761. "C_REG": "0",
  114762. "D_REG": "0",
  114763. "MODE_8x8": "0",
  114764. "NEG_TRIGGER": "0",
  114765. "PIPELINE_16x16_MULT_REG1": "0",
  114766. "PIPELINE_16x16_MULT_REG2": "0",
  114767. "TOPADDSUB_CARRYSELECT": "11",
  114768. "TOPADDSUB_LOWERINPUT": "10",
  114769. "TOPADDSUB_UPPERINPUT": "1",
  114770. "TOPOUTPUT_SELECT": "01",
  114771. "TOP_8x8_MULT_REG": "0"
  114772. },
  114773. "attributes": {
  114774. "module_not_derived": "00000000000000000000000000000001",
  114775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2490.28-2490.77|/usr/bin/../share/yosys/mul2dsp.v:253.6-257.5|/usr/bin/../share/yosys/ice40/dsp_map.v:29.4-33.3"
  114776. },
  114777. "port_directions": {
  114778. "A": "input",
  114779. "ACCUMCI": "input",
  114780. "ACCUMCO": "output",
  114781. "ADDSUBBOT": "input",
  114782. "ADDSUBTOP": "input",
  114783. "AHOLD": "input",
  114784. "B": "input",
  114785. "BHOLD": "input",
  114786. "C": "input",
  114787. "CE": "input",
  114788. "CHOLD": "input",
  114789. "CI": "input",
  114790. "CLK": "input",
  114791. "CO": "output",
  114792. "D": "input",
  114793. "DHOLD": "input",
  114794. "IRSTBOT": "input",
  114795. "IRSTTOP": "input",
  114796. "O": "output",
  114797. "OHOLDBOT": "input",
  114798. "OHOLDTOP": "input",
  114799. "OLOADBOT": "input",
  114800. "OLOADTOP": "input",
  114801. "ORSTBOT": "input",
  114802. "ORSTTOP": "input",
  114803. "SIGNEXTIN": "input",
  114804. "SIGNEXTOUT": "output"
  114805. },
  114806. "connections": {
  114807. "A": [ 3710, 3761, 3714, 3827, 3822, 3817, 3812, 3799, 3754, 3712, 3806, 3801, 3795, 3790, 3785, 3782 ],
  114808. "ACCUMCI": [ "x" ],
  114809. "ACCUMCO": [ 5023 ],
  114810. "ADDSUBBOT": [ "0" ],
  114811. "ADDSUBTOP": [ "0" ],
  114812. "AHOLD": [ 1020 ],
  114813. "B": [ 3843, 3895, 3847, 3953, 3950, 3947, 3944, 3933, 3890, 3845, 3938, 3935, 3925, 3922, 3919, 3914 ],
  114814. "BHOLD": [ 1020 ],
  114815. "C": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  114816. "CE": [ "1" ],
  114817. "CHOLD": [ "0" ],
  114818. "CI": [ "x" ],
  114819. "CLK": [ 42 ],
  114820. "CO": [ 5024 ],
  114821. "D": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  114822. "DHOLD": [ "0" ],
  114823. "IRSTBOT": [ "0" ],
  114824. "IRSTTOP": [ "0" ],
  114825. "O": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5041, 5042, 5043, 5044, 5045, 5046, 5047, 5048, 5049, 5050, 5051, 5052, 5053, 5054, 5055, 5056 ],
  114826. "OHOLDBOT": [ 1018 ],
  114827. "OHOLDTOP": [ 1018 ],
  114828. "OLOADBOT": [ "0" ],
  114829. "OLOADTOP": [ "0" ],
  114830. "ORSTBOT": [ "0" ],
  114831. "ORSTTOP": [ "0" ],
  114832. "SIGNEXTIN": [ "x" ],
  114833. "SIGNEXTOUT": [ 5057 ]
  114834. }
  114835. },
  114836. "cpu_I.execute_to_memory_PC_SB_DFFE_Q": {
  114837. "hide_name": 0,
  114838. "type": "SB_DFFE",
  114839. "parameters": {
  114840. },
  114841. "attributes": {
  114842. "module_not_derived": "00000000000000000000000000000001",
  114843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114844. },
  114845. "port_directions": {
  114846. "C": "input",
  114847. "D": "input",
  114848. "E": "input",
  114849. "Q": "output"
  114850. },
  114851. "connections": {
  114852. "C": [ 42 ],
  114853. "D": [ 4249 ],
  114854. "E": [ 3995 ],
  114855. "Q": [ 5058 ]
  114856. }
  114857. },
  114858. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_1": {
  114859. "hide_name": 0,
  114860. "type": "SB_DFFE",
  114861. "parameters": {
  114862. },
  114863. "attributes": {
  114864. "module_not_derived": "00000000000000000000000000000001",
  114865. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114866. },
  114867. "port_directions": {
  114868. "C": "input",
  114869. "D": "input",
  114870. "E": "input",
  114871. "Q": "output"
  114872. },
  114873. "connections": {
  114874. "C": [ 42 ],
  114875. "D": [ 4250 ],
  114876. "E": [ 3995 ],
  114877. "Q": [ 5059 ]
  114878. }
  114879. },
  114880. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_10": {
  114881. "hide_name": 0,
  114882. "type": "SB_DFFE",
  114883. "parameters": {
  114884. },
  114885. "attributes": {
  114886. "module_not_derived": "00000000000000000000000000000001",
  114887. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114888. },
  114889. "port_directions": {
  114890. "C": "input",
  114891. "D": "input",
  114892. "E": "input",
  114893. "Q": "output"
  114894. },
  114895. "connections": {
  114896. "C": [ 42 ],
  114897. "D": [ 4251 ],
  114898. "E": [ 3995 ],
  114899. "Q": [ 5060 ]
  114900. }
  114901. },
  114902. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_11": {
  114903. "hide_name": 0,
  114904. "type": "SB_DFFE",
  114905. "parameters": {
  114906. },
  114907. "attributes": {
  114908. "module_not_derived": "00000000000000000000000000000001",
  114909. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114910. },
  114911. "port_directions": {
  114912. "C": "input",
  114913. "D": "input",
  114914. "E": "input",
  114915. "Q": "output"
  114916. },
  114917. "connections": {
  114918. "C": [ 42 ],
  114919. "D": [ 2932 ],
  114920. "E": [ 3995 ],
  114921. "Q": [ 5061 ]
  114922. }
  114923. },
  114924. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_12": {
  114925. "hide_name": 0,
  114926. "type": "SB_DFFE",
  114927. "parameters": {
  114928. },
  114929. "attributes": {
  114930. "module_not_derived": "00000000000000000000000000000001",
  114931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114932. },
  114933. "port_directions": {
  114934. "C": "input",
  114935. "D": "input",
  114936. "E": "input",
  114937. "Q": "output"
  114938. },
  114939. "connections": {
  114940. "C": [ 42 ],
  114941. "D": [ 4252 ],
  114942. "E": [ 3995 ],
  114943. "Q": [ 5062 ]
  114944. }
  114945. },
  114946. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_13": {
  114947. "hide_name": 0,
  114948. "type": "SB_DFFE",
  114949. "parameters": {
  114950. },
  114951. "attributes": {
  114952. "module_not_derived": "00000000000000000000000000000001",
  114953. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114954. },
  114955. "port_directions": {
  114956. "C": "input",
  114957. "D": "input",
  114958. "E": "input",
  114959. "Q": "output"
  114960. },
  114961. "connections": {
  114962. "C": [ 42 ],
  114963. "D": [ 4253 ],
  114964. "E": [ 3995 ],
  114965. "Q": [ 5063 ]
  114966. }
  114967. },
  114968. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_14": {
  114969. "hide_name": 0,
  114970. "type": "SB_DFFE",
  114971. "parameters": {
  114972. },
  114973. "attributes": {
  114974. "module_not_derived": "00000000000000000000000000000001",
  114975. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114976. },
  114977. "port_directions": {
  114978. "C": "input",
  114979. "D": "input",
  114980. "E": "input",
  114981. "Q": "output"
  114982. },
  114983. "connections": {
  114984. "C": [ 42 ],
  114985. "D": [ 4254 ],
  114986. "E": [ 3995 ],
  114987. "Q": [ 5064 ]
  114988. }
  114989. },
  114990. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_15": {
  114991. "hide_name": 0,
  114992. "type": "SB_DFFE",
  114993. "parameters": {
  114994. },
  114995. "attributes": {
  114996. "module_not_derived": "00000000000000000000000000000001",
  114997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  114998. },
  114999. "port_directions": {
  115000. "C": "input",
  115001. "D": "input",
  115002. "E": "input",
  115003. "Q": "output"
  115004. },
  115005. "connections": {
  115006. "C": [ 42 ],
  115007. "D": [ 2911 ],
  115008. "E": [ 3995 ],
  115009. "Q": [ 5065 ]
  115010. }
  115011. },
  115012. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_16": {
  115013. "hide_name": 0,
  115014. "type": "SB_DFFE",
  115015. "parameters": {
  115016. },
  115017. "attributes": {
  115018. "module_not_derived": "00000000000000000000000000000001",
  115019. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115020. },
  115021. "port_directions": {
  115022. "C": "input",
  115023. "D": "input",
  115024. "E": "input",
  115025. "Q": "output"
  115026. },
  115027. "connections": {
  115028. "C": [ 42 ],
  115029. "D": [ 4255 ],
  115030. "E": [ 3995 ],
  115031. "Q": [ 5066 ]
  115032. }
  115033. },
  115034. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_17": {
  115035. "hide_name": 0,
  115036. "type": "SB_DFFE",
  115037. "parameters": {
  115038. },
  115039. "attributes": {
  115040. "module_not_derived": "00000000000000000000000000000001",
  115041. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115042. },
  115043. "port_directions": {
  115044. "C": "input",
  115045. "D": "input",
  115046. "E": "input",
  115047. "Q": "output"
  115048. },
  115049. "connections": {
  115050. "C": [ 42 ],
  115051. "D": [ 2896 ],
  115052. "E": [ 3995 ],
  115053. "Q": [ 5067 ]
  115054. }
  115055. },
  115056. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_18": {
  115057. "hide_name": 0,
  115058. "type": "SB_DFFE",
  115059. "parameters": {
  115060. },
  115061. "attributes": {
  115062. "module_not_derived": "00000000000000000000000000000001",
  115063. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115064. },
  115065. "port_directions": {
  115066. "C": "input",
  115067. "D": "input",
  115068. "E": "input",
  115069. "Q": "output"
  115070. },
  115071. "connections": {
  115072. "C": [ 42 ],
  115073. "D": [ 4256 ],
  115074. "E": [ 3995 ],
  115075. "Q": [ 5068 ]
  115076. }
  115077. },
  115078. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_19": {
  115079. "hide_name": 0,
  115080. "type": "SB_DFFE",
  115081. "parameters": {
  115082. },
  115083. "attributes": {
  115084. "module_not_derived": "00000000000000000000000000000001",
  115085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115086. },
  115087. "port_directions": {
  115088. "C": "input",
  115089. "D": "input",
  115090. "E": "input",
  115091. "Q": "output"
  115092. },
  115093. "connections": {
  115094. "C": [ 42 ],
  115095. "D": [ 2880 ],
  115096. "E": [ 3995 ],
  115097. "Q": [ 5069 ]
  115098. }
  115099. },
  115100. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_2": {
  115101. "hide_name": 0,
  115102. "type": "SB_DFFE",
  115103. "parameters": {
  115104. },
  115105. "attributes": {
  115106. "module_not_derived": "00000000000000000000000000000001",
  115107. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115108. },
  115109. "port_directions": {
  115110. "C": "input",
  115111. "D": "input",
  115112. "E": "input",
  115113. "Q": "output"
  115114. },
  115115. "connections": {
  115116. "C": [ 42 ],
  115117. "D": [ 4257 ],
  115118. "E": [ 3995 ],
  115119. "Q": [ 5070 ]
  115120. }
  115121. },
  115122. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_20": {
  115123. "hide_name": 0,
  115124. "type": "SB_DFFE",
  115125. "parameters": {
  115126. },
  115127. "attributes": {
  115128. "module_not_derived": "00000000000000000000000000000001",
  115129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115130. },
  115131. "port_directions": {
  115132. "C": "input",
  115133. "D": "input",
  115134. "E": "input",
  115135. "Q": "output"
  115136. },
  115137. "connections": {
  115138. "C": [ 42 ],
  115139. "D": [ 2867 ],
  115140. "E": [ 3995 ],
  115141. "Q": [ 5071 ]
  115142. }
  115143. },
  115144. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_21": {
  115145. "hide_name": 0,
  115146. "type": "SB_DFFE",
  115147. "parameters": {
  115148. },
  115149. "attributes": {
  115150. "module_not_derived": "00000000000000000000000000000001",
  115151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115152. },
  115153. "port_directions": {
  115154. "C": "input",
  115155. "D": "input",
  115156. "E": "input",
  115157. "Q": "output"
  115158. },
  115159. "connections": {
  115160. "C": [ 42 ],
  115161. "D": [ 3074 ],
  115162. "E": [ 3995 ],
  115163. "Q": [ 5072 ]
  115164. }
  115165. },
  115166. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_22": {
  115167. "hide_name": 0,
  115168. "type": "SB_DFFE",
  115169. "parameters": {
  115170. },
  115171. "attributes": {
  115172. "module_not_derived": "00000000000000000000000000000001",
  115173. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115174. },
  115175. "port_directions": {
  115176. "C": "input",
  115177. "D": "input",
  115178. "E": "input",
  115179. "Q": "output"
  115180. },
  115181. "connections": {
  115182. "C": [ 42 ],
  115183. "D": [ 4258 ],
  115184. "E": [ 3995 ],
  115185. "Q": [ 5073 ]
  115186. }
  115187. },
  115188. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_23": {
  115189. "hide_name": 0,
  115190. "type": "SB_DFFE",
  115191. "parameters": {
  115192. },
  115193. "attributes": {
  115194. "module_not_derived": "00000000000000000000000000000001",
  115195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115196. },
  115197. "port_directions": {
  115198. "C": "input",
  115199. "D": "input",
  115200. "E": "input",
  115201. "Q": "output"
  115202. },
  115203. "connections": {
  115204. "C": [ 42 ],
  115205. "D": [ 3059 ],
  115206. "E": [ 3995 ],
  115207. "Q": [ 5074 ]
  115208. }
  115209. },
  115210. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_24": {
  115211. "hide_name": 0,
  115212. "type": "SB_DFFE",
  115213. "parameters": {
  115214. },
  115215. "attributes": {
  115216. "module_not_derived": "00000000000000000000000000000001",
  115217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115218. },
  115219. "port_directions": {
  115220. "C": "input",
  115221. "D": "input",
  115222. "E": "input",
  115223. "Q": "output"
  115224. },
  115225. "connections": {
  115226. "C": [ 42 ],
  115227. "D": [ 3045 ],
  115228. "E": [ 3995 ],
  115229. "Q": [ 5075 ]
  115230. }
  115231. },
  115232. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_25": {
  115233. "hide_name": 0,
  115234. "type": "SB_DFFE",
  115235. "parameters": {
  115236. },
  115237. "attributes": {
  115238. "module_not_derived": "00000000000000000000000000000001",
  115239. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115240. },
  115241. "port_directions": {
  115242. "C": "input",
  115243. "D": "input",
  115244. "E": "input",
  115245. "Q": "output"
  115246. },
  115247. "connections": {
  115248. "C": [ 42 ],
  115249. "D": [ 3034 ],
  115250. "E": [ 3995 ],
  115251. "Q": [ 5076 ]
  115252. }
  115253. },
  115254. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_26": {
  115255. "hide_name": 0,
  115256. "type": "SB_DFFE",
  115257. "parameters": {
  115258. },
  115259. "attributes": {
  115260. "module_not_derived": "00000000000000000000000000000001",
  115261. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115262. },
  115263. "port_directions": {
  115264. "C": "input",
  115265. "D": "input",
  115266. "E": "input",
  115267. "Q": "output"
  115268. },
  115269. "connections": {
  115270. "C": [ 42 ],
  115271. "D": [ 3014 ],
  115272. "E": [ 3995 ],
  115273. "Q": [ 5077 ]
  115274. }
  115275. },
  115276. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_27": {
  115277. "hide_name": 0,
  115278. "type": "SB_DFFE",
  115279. "parameters": {
  115280. },
  115281. "attributes": {
  115282. "module_not_derived": "00000000000000000000000000000001",
  115283. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115284. },
  115285. "port_directions": {
  115286. "C": "input",
  115287. "D": "input",
  115288. "E": "input",
  115289. "Q": "output"
  115290. },
  115291. "connections": {
  115292. "C": [ 42 ],
  115293. "D": [ 4259 ],
  115294. "E": [ 3995 ],
  115295. "Q": [ 5078 ]
  115296. }
  115297. },
  115298. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_28": {
  115299. "hide_name": 0,
  115300. "type": "SB_DFFE",
  115301. "parameters": {
  115302. },
  115303. "attributes": {
  115304. "module_not_derived": "00000000000000000000000000000001",
  115305. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115306. },
  115307. "port_directions": {
  115308. "C": "input",
  115309. "D": "input",
  115310. "E": "input",
  115311. "Q": "output"
  115312. },
  115313. "connections": {
  115314. "C": [ 42 ],
  115315. "D": [ 4260 ],
  115316. "E": [ 3995 ],
  115317. "Q": [ 5079 ]
  115318. }
  115319. },
  115320. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_29": {
  115321. "hide_name": 0,
  115322. "type": "SB_DFFE",
  115323. "parameters": {
  115324. },
  115325. "attributes": {
  115326. "module_not_derived": "00000000000000000000000000000001",
  115327. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115328. },
  115329. "port_directions": {
  115330. "C": "input",
  115331. "D": "input",
  115332. "E": "input",
  115333. "Q": "output"
  115334. },
  115335. "connections": {
  115336. "C": [ 42 ],
  115337. "D": [ 4261 ],
  115338. "E": [ 3995 ],
  115339. "Q": [ 5080 ]
  115340. }
  115341. },
  115342. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_3": {
  115343. "hide_name": 0,
  115344. "type": "SB_DFFE",
  115345. "parameters": {
  115346. },
  115347. "attributes": {
  115348. "module_not_derived": "00000000000000000000000000000001",
  115349. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115350. },
  115351. "port_directions": {
  115352. "C": "input",
  115353. "D": "input",
  115354. "E": "input",
  115355. "Q": "output"
  115356. },
  115357. "connections": {
  115358. "C": [ 42 ],
  115359. "D": [ 2994 ],
  115360. "E": [ 3995 ],
  115361. "Q": [ 5081 ]
  115362. }
  115363. },
  115364. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_4": {
  115365. "hide_name": 0,
  115366. "type": "SB_DFFE",
  115367. "parameters": {
  115368. },
  115369. "attributes": {
  115370. "module_not_derived": "00000000000000000000000000000001",
  115371. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115372. },
  115373. "port_directions": {
  115374. "C": "input",
  115375. "D": "input",
  115376. "E": "input",
  115377. "Q": "output"
  115378. },
  115379. "connections": {
  115380. "C": [ 42 ],
  115381. "D": [ 4262 ],
  115382. "E": [ 3995 ],
  115383. "Q": [ 5082 ]
  115384. }
  115385. },
  115386. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_5": {
  115387. "hide_name": 0,
  115388. "type": "SB_DFFE",
  115389. "parameters": {
  115390. },
  115391. "attributes": {
  115392. "module_not_derived": "00000000000000000000000000000001",
  115393. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115394. },
  115395. "port_directions": {
  115396. "C": "input",
  115397. "D": "input",
  115398. "E": "input",
  115399. "Q": "output"
  115400. },
  115401. "connections": {
  115402. "C": [ 42 ],
  115403. "D": [ 4263 ],
  115404. "E": [ 3995 ],
  115405. "Q": [ 5083 ]
  115406. }
  115407. },
  115408. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_6": {
  115409. "hide_name": 0,
  115410. "type": "SB_DFFE",
  115411. "parameters": {
  115412. },
  115413. "attributes": {
  115414. "module_not_derived": "00000000000000000000000000000001",
  115415. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115416. },
  115417. "port_directions": {
  115418. "C": "input",
  115419. "D": "input",
  115420. "E": "input",
  115421. "Q": "output"
  115422. },
  115423. "connections": {
  115424. "C": [ 42 ],
  115425. "D": [ 4264 ],
  115426. "E": [ 3995 ],
  115427. "Q": [ 5084 ]
  115428. }
  115429. },
  115430. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_7": {
  115431. "hide_name": 0,
  115432. "type": "SB_DFFE",
  115433. "parameters": {
  115434. },
  115435. "attributes": {
  115436. "module_not_derived": "00000000000000000000000000000001",
  115437. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115438. },
  115439. "port_directions": {
  115440. "C": "input",
  115441. "D": "input",
  115442. "E": "input",
  115443. "Q": "output"
  115444. },
  115445. "connections": {
  115446. "C": [ 42 ],
  115447. "D": [ 4265 ],
  115448. "E": [ 3995 ],
  115449. "Q": [ 5085 ]
  115450. }
  115451. },
  115452. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_8": {
  115453. "hide_name": 0,
  115454. "type": "SB_DFFE",
  115455. "parameters": {
  115456. },
  115457. "attributes": {
  115458. "module_not_derived": "00000000000000000000000000000001",
  115459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115460. },
  115461. "port_directions": {
  115462. "C": "input",
  115463. "D": "input",
  115464. "E": "input",
  115465. "Q": "output"
  115466. },
  115467. "connections": {
  115468. "C": [ 42 ],
  115469. "D": [ 2952 ],
  115470. "E": [ 3995 ],
  115471. "Q": [ 5086 ]
  115472. }
  115473. },
  115474. "cpu_I.execute_to_memory_PC_SB_DFFE_Q_9": {
  115475. "hide_name": 0,
  115476. "type": "SB_DFFE",
  115477. "parameters": {
  115478. },
  115479. "attributes": {
  115480. "module_not_derived": "00000000000000000000000000000001",
  115481. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115482. },
  115483. "port_directions": {
  115484. "C": "input",
  115485. "D": "input",
  115486. "E": "input",
  115487. "Q": "output"
  115488. },
  115489. "connections": {
  115490. "C": [ 42 ],
  115491. "D": [ 4266 ],
  115492. "E": [ 3995 ],
  115493. "Q": [ 5087 ]
  115494. }
  115495. },
  115496. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q": {
  115497. "hide_name": 0,
  115498. "type": "SB_DFFE",
  115499. "parameters": {
  115500. },
  115501. "attributes": {
  115502. "module_not_derived": "00000000000000000000000000000001",
  115503. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115504. },
  115505. "port_directions": {
  115506. "C": "input",
  115507. "D": "input",
  115508. "E": "input",
  115509. "Q": "output"
  115510. },
  115511. "connections": {
  115512. "C": [ 42 ],
  115513. "D": [ 2971 ],
  115514. "E": [ 3995 ],
  115515. "Q": [ 3173 ]
  115516. }
  115517. },
  115518. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_1": {
  115519. "hide_name": 0,
  115520. "type": "SB_DFFE",
  115521. "parameters": {
  115522. },
  115523. "attributes": {
  115524. "module_not_derived": "00000000000000000000000000000001",
  115525. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115526. },
  115527. "port_directions": {
  115528. "C": "input",
  115529. "D": "input",
  115530. "E": "input",
  115531. "Q": "output"
  115532. },
  115533. "connections": {
  115534. "C": [ 42 ],
  115535. "D": [ 2969 ],
  115536. "E": [ 3995 ],
  115537. "Q": [ 3190 ]
  115538. }
  115539. },
  115540. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_10": {
  115541. "hide_name": 0,
  115542. "type": "SB_DFFE",
  115543. "parameters": {
  115544. },
  115545. "attributes": {
  115546. "module_not_derived": "00000000000000000000000000000001",
  115547. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115548. },
  115549. "port_directions": {
  115550. "C": "input",
  115551. "D": "input",
  115552. "E": "input",
  115553. "Q": "output"
  115554. },
  115555. "connections": {
  115556. "C": [ 42 ],
  115557. "D": [ 2939 ],
  115558. "E": [ 3995 ],
  115559. "Q": [ 3223 ]
  115560. }
  115561. },
  115562. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_11": {
  115563. "hide_name": 0,
  115564. "type": "SB_DFFE",
  115565. "parameters": {
  115566. },
  115567. "attributes": {
  115568. "module_not_derived": "00000000000000000000000000000001",
  115569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115570. },
  115571. "port_directions": {
  115572. "C": "input",
  115573. "D": "input",
  115574. "E": "input",
  115575. "Q": "output"
  115576. },
  115577. "connections": {
  115578. "C": [ 42 ],
  115579. "D": [ 2925 ],
  115580. "E": [ 3995 ],
  115581. "Q": [ 3126 ]
  115582. }
  115583. },
  115584. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_12": {
  115585. "hide_name": 0,
  115586. "type": "SB_DFFE",
  115587. "parameters": {
  115588. },
  115589. "attributes": {
  115590. "module_not_derived": "00000000000000000000000000000001",
  115591. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115592. },
  115593. "port_directions": {
  115594. "C": "input",
  115595. "D": "input",
  115596. "E": "input",
  115597. "Q": "output"
  115598. },
  115599. "connections": {
  115600. "C": [ 42 ],
  115601. "D": [ 2922 ],
  115602. "E": [ 3995 ],
  115603. "Q": [ 3119 ]
  115604. }
  115605. },
  115606. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_13": {
  115607. "hide_name": 0,
  115608. "type": "SB_DFFE",
  115609. "parameters": {
  115610. },
  115611. "attributes": {
  115612. "module_not_derived": "00000000000000000000000000000001",
  115613. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115614. },
  115615. "port_directions": {
  115616. "C": "input",
  115617. "D": "input",
  115618. "E": "input",
  115619. "Q": "output"
  115620. },
  115621. "connections": {
  115622. "C": [ 42 ],
  115623. "D": [ 2919 ],
  115624. "E": [ 3995 ],
  115625. "Q": [ 3112 ]
  115626. }
  115627. },
  115628. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_14": {
  115629. "hide_name": 0,
  115630. "type": "SB_DFFE",
  115631. "parameters": {
  115632. },
  115633. "attributes": {
  115634. "module_not_derived": "00000000000000000000000000000001",
  115635. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115636. },
  115637. "port_directions": {
  115638. "C": "input",
  115639. "D": "input",
  115640. "E": "input",
  115641. "Q": "output"
  115642. },
  115643. "connections": {
  115644. "C": [ 42 ],
  115645. "D": [ 2916 ],
  115646. "E": [ 3995 ],
  115647. "Q": [ 3105 ]
  115648. }
  115649. },
  115650. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_15": {
  115651. "hide_name": 0,
  115652. "type": "SB_DFFE",
  115653. "parameters": {
  115654. },
  115655. "attributes": {
  115656. "module_not_derived": "00000000000000000000000000000001",
  115657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115658. },
  115659. "port_directions": {
  115660. "C": "input",
  115661. "D": "input",
  115662. "E": "input",
  115663. "Q": "output"
  115664. },
  115665. "connections": {
  115666. "C": [ 42 ],
  115667. "D": [ 2904 ],
  115668. "E": [ 3995 ],
  115669. "Q": [ 3100 ]
  115670. }
  115671. },
  115672. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_16": {
  115673. "hide_name": 0,
  115674. "type": "SB_DFFE",
  115675. "parameters": {
  115676. },
  115677. "attributes": {
  115678. "module_not_derived": "00000000000000000000000000000001",
  115679. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115680. },
  115681. "port_directions": {
  115682. "C": "input",
  115683. "D": "input",
  115684. "E": "input",
  115685. "Q": "output"
  115686. },
  115687. "connections": {
  115688. "C": [ 42 ],
  115689. "D": [ 2901 ],
  115690. "E": [ 3995 ],
  115691. "Q": [ 3089 ]
  115692. }
  115693. },
  115694. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_17": {
  115695. "hide_name": 0,
  115696. "type": "SB_DFFE",
  115697. "parameters": {
  115698. },
  115699. "attributes": {
  115700. "module_not_derived": "00000000000000000000000000000001",
  115701. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115702. },
  115703. "port_directions": {
  115704. "C": "input",
  115705. "D": "input",
  115706. "E": "input",
  115707. "Q": "output"
  115708. },
  115709. "connections": {
  115710. "C": [ 42 ],
  115711. "D": [ 2888 ],
  115712. "E": [ 3995 ],
  115713. "Q": [ 3272 ]
  115714. }
  115715. },
  115716. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_18": {
  115717. "hide_name": 0,
  115718. "type": "SB_DFFE",
  115719. "parameters": {
  115720. },
  115721. "attributes": {
  115722. "module_not_derived": "00000000000000000000000000000001",
  115723. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115724. },
  115725. "port_directions": {
  115726. "C": "input",
  115727. "D": "input",
  115728. "E": "input",
  115729. "Q": "output"
  115730. },
  115731. "connections": {
  115732. "C": [ 42 ],
  115733. "D": [ 2885 ],
  115734. "E": [ 3995 ],
  115735. "Q": [ 3267 ]
  115736. }
  115737. },
  115738. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_19": {
  115739. "hide_name": 0,
  115740. "type": "SB_DFFE",
  115741. "parameters": {
  115742. },
  115743. "attributes": {
  115744. "module_not_derived": "00000000000000000000000000000001",
  115745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115746. },
  115747. "port_directions": {
  115748. "C": "input",
  115749. "D": "input",
  115750. "E": "input",
  115751. "Q": "output"
  115752. },
  115753. "connections": {
  115754. "C": [ 42 ],
  115755. "D": [ 2875 ],
  115756. "E": [ 3995 ],
  115757. "Q": [ 3262 ]
  115758. }
  115759. },
  115760. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_2": {
  115761. "hide_name": 0,
  115762. "type": "SB_DFFE",
  115763. "parameters": {
  115764. },
  115765. "attributes": {
  115766. "module_not_derived": "00000000000000000000000000000001",
  115767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115768. },
  115769. "port_directions": {
  115770. "C": "input",
  115771. "D": "input",
  115772. "E": "input",
  115773. "Q": "output"
  115774. },
  115775. "connections": {
  115776. "C": [ 42 ],
  115777. "D": [ 2980 ],
  115778. "E": [ 3995 ],
  115779. "Q": [ 3204 ]
  115780. }
  115781. },
  115782. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_20": {
  115783. "hide_name": 0,
  115784. "type": "SB_DFFE",
  115785. "parameters": {
  115786. },
  115787. "attributes": {
  115788. "module_not_derived": "00000000000000000000000000000001",
  115789. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115790. },
  115791. "port_directions": {
  115792. "C": "input",
  115793. "D": "input",
  115794. "E": "input",
  115795. "Q": "output"
  115796. },
  115797. "connections": {
  115798. "C": [ 42 ],
  115799. "D": [ 2863 ],
  115800. "E": [ 3995 ],
  115801. "Q": [ 3257 ]
  115802. }
  115803. },
  115804. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_21": {
  115805. "hide_name": 0,
  115806. "type": "SB_DFFE",
  115807. "parameters": {
  115808. },
  115809. "attributes": {
  115810. "module_not_derived": "00000000000000000000000000000001",
  115811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115812. },
  115813. "port_directions": {
  115814. "C": "input",
  115815. "D": "input",
  115816. "E": "input",
  115817. "Q": "output"
  115818. },
  115819. "connections": {
  115820. "C": [ 42 ],
  115821. "D": [ 3067 ],
  115822. "E": [ 3995 ],
  115823. "Q": [ 3240 ]
  115824. }
  115825. },
  115826. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_22": {
  115827. "hide_name": 0,
  115828. "type": "SB_DFFE",
  115829. "parameters": {
  115830. },
  115831. "attributes": {
  115832. "module_not_derived": "00000000000000000000000000000001",
  115833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115834. },
  115835. "port_directions": {
  115836. "C": "input",
  115837. "D": "input",
  115838. "E": "input",
  115839. "Q": "output"
  115840. },
  115841. "connections": {
  115842. "C": [ 42 ],
  115843. "D": [ 3064 ],
  115844. "E": [ 3995 ],
  115845. "Q": [ 3252 ]
  115846. }
  115847. },
  115848. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_23": {
  115849. "hide_name": 0,
  115850. "type": "SB_DFFE",
  115851. "parameters": {
  115852. },
  115853. "attributes": {
  115854. "module_not_derived": "00000000000000000000000000000001",
  115855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115856. },
  115857. "port_directions": {
  115858. "C": "input",
  115859. "D": "input",
  115860. "E": "input",
  115861. "Q": "output"
  115862. },
  115863. "connections": {
  115864. "C": [ 42 ],
  115865. "D": [ 3050 ],
  115866. "E": [ 3995 ],
  115867. "Q": [ 3185 ]
  115868. }
  115869. },
  115870. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_24": {
  115871. "hide_name": 0,
  115872. "type": "SB_DFFE",
  115873. "parameters": {
  115874. },
  115875. "attributes": {
  115876. "module_not_derived": "00000000000000000000000000000001",
  115877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115878. },
  115879. "port_directions": {
  115880. "C": "input",
  115881. "D": "input",
  115882. "E": "input",
  115883. "Q": "output"
  115884. },
  115885. "connections": {
  115886. "C": [ 42 ],
  115887. "D": [ 3038 ],
  115888. "E": [ 3995 ],
  115889. "Q": [ 3247 ]
  115890. }
  115891. },
  115892. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_25": {
  115893. "hide_name": 0,
  115894. "type": "SB_DFFE",
  115895. "parameters": {
  115896. },
  115897. "attributes": {
  115898. "module_not_derived": "00000000000000000000000000000001",
  115899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115900. },
  115901. "port_directions": {
  115902. "C": "input",
  115903. "D": "input",
  115904. "E": "input",
  115905. "Q": "output"
  115906. },
  115907. "connections": {
  115908. "C": [ 42 ],
  115909. "D": [ 3025 ],
  115910. "E": [ 3995 ],
  115911. "Q": [ 3242 ]
  115912. }
  115913. },
  115914. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_26": {
  115915. "hide_name": 0,
  115916. "type": "SB_DFFE",
  115917. "parameters": {
  115918. },
  115919. "attributes": {
  115920. "module_not_derived": "00000000000000000000000000000001",
  115921. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115922. },
  115923. "port_directions": {
  115924. "C": "input",
  115925. "D": "input",
  115926. "E": "input",
  115927. "Q": "output"
  115928. },
  115929. "connections": {
  115930. "C": [ 42 ],
  115931. "D": [ 3003 ],
  115932. "E": [ 3995 ],
  115933. "Q": [ 3227 ]
  115934. }
  115935. },
  115936. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_27": {
  115937. "hide_name": 0,
  115938. "type": "SB_DFFE",
  115939. "parameters": {
  115940. },
  115941. "attributes": {
  115942. "module_not_derived": "00000000000000000000000000000001",
  115943. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115944. },
  115945. "port_directions": {
  115946. "C": "input",
  115947. "D": "input",
  115948. "E": "input",
  115949. "Q": "output"
  115950. },
  115951. "connections": {
  115952. "C": [ 42 ],
  115953. "D": [ 2976 ],
  115954. "E": [ 3995 ],
  115955. "Q": [ 3158 ]
  115956. }
  115957. },
  115958. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_28": {
  115959. "hide_name": 0,
  115960. "type": "SB_DFFE",
  115961. "parameters": {
  115962. },
  115963. "attributes": {
  115964. "module_not_derived": "00000000000000000000000000000001",
  115965. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115966. },
  115967. "port_directions": {
  115968. "C": "input",
  115969. "D": "input",
  115970. "E": "input",
  115971. "Q": "output"
  115972. },
  115973. "connections": {
  115974. "C": [ 42 ],
  115975. "D": [ 2936 ],
  115976. "E": [ 3995 ],
  115977. "Q": [ 3274 ]
  115978. }
  115979. },
  115980. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_29": {
  115981. "hide_name": 0,
  115982. "type": "SB_DFFE",
  115983. "parameters": {
  115984. },
  115985. "attributes": {
  115986. "module_not_derived": "00000000000000000000000000000001",
  115987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  115988. },
  115989. "port_directions": {
  115990. "C": "input",
  115991. "D": "input",
  115992. "E": "input",
  115993. "Q": "output"
  115994. },
  115995. "connections": {
  115996. "C": [ 42 ],
  115997. "D": [ 2861 ],
  115998. "E": [ 3995 ],
  115999. "Q": [ 3197 ]
  116000. }
  116001. },
  116002. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_3": {
  116003. "hide_name": 0,
  116004. "type": "SB_DFFE",
  116005. "parameters": {
  116006. },
  116007. "attributes": {
  116008. "module_not_derived": "00000000000000000000000000000001",
  116009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116010. },
  116011. "port_directions": {
  116012. "C": "input",
  116013. "D": "input",
  116014. "E": "input",
  116015. "Q": "output"
  116016. },
  116017. "connections": {
  116018. "C": [ 42 ],
  116019. "D": [ 2984 ],
  116020. "E": [ 3995 ],
  116021. "Q": [ 3209 ]
  116022. }
  116023. },
  116024. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_30": {
  116025. "hide_name": 0,
  116026. "type": "SB_DFFE",
  116027. "parameters": {
  116028. },
  116029. "attributes": {
  116030. "module_not_derived": "00000000000000000000000000000001",
  116031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116032. },
  116033. "port_directions": {
  116034. "C": "input",
  116035. "D": "input",
  116036. "E": "input",
  116037. "Q": "output"
  116038. },
  116039. "connections": {
  116040. "C": [ 42 ],
  116041. "D": [ 2860 ],
  116042. "E": [ 3995 ],
  116043. "Q": [ 3235 ]
  116044. }
  116045. },
  116046. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_31": {
  116047. "hide_name": 0,
  116048. "type": "SB_DFFE",
  116049. "parameters": {
  116050. },
  116051. "attributes": {
  116052. "module_not_derived": "00000000000000000000000000000001",
  116053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116054. },
  116055. "port_directions": {
  116056. "C": "input",
  116057. "D": "input",
  116058. "E": "input",
  116059. "Q": "output"
  116060. },
  116061. "connections": {
  116062. "C": [ 42 ],
  116063. "D": [ 2970 ],
  116064. "E": [ 3995 ],
  116065. "Q": [ 3180 ]
  116066. }
  116067. },
  116068. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_4": {
  116069. "hide_name": 0,
  116070. "type": "SB_DFFE",
  116071. "parameters": {
  116072. },
  116073. "attributes": {
  116074. "module_not_derived": "00000000000000000000000000000001",
  116075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116076. },
  116077. "port_directions": {
  116078. "C": "input",
  116079. "D": "input",
  116080. "E": "input",
  116081. "Q": "output"
  116082. },
  116083. "connections": {
  116084. "C": [ 42 ],
  116085. "D": [ 2966 ],
  116086. "E": [ 3995 ],
  116087. "Q": [ 3168 ]
  116088. }
  116089. },
  116090. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_5": {
  116091. "hide_name": 0,
  116092. "type": "SB_DFFE",
  116093. "parameters": {
  116094. },
  116095. "attributes": {
  116096. "module_not_derived": "00000000000000000000000000000001",
  116097. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116098. },
  116099. "port_directions": {
  116100. "C": "input",
  116101. "D": "input",
  116102. "E": "input",
  116103. "Q": "output"
  116104. },
  116105. "connections": {
  116106. "C": [ 42 ],
  116107. "D": [ 2963 ],
  116108. "E": [ 3995 ],
  116109. "Q": [ 3154 ]
  116110. }
  116111. },
  116112. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_6": {
  116113. "hide_name": 0,
  116114. "type": "SB_DFFE",
  116115. "parameters": {
  116116. },
  116117. "attributes": {
  116118. "module_not_derived": "00000000000000000000000000000001",
  116119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116120. },
  116121. "port_directions": {
  116122. "C": "input",
  116123. "D": "input",
  116124. "E": "input",
  116125. "Q": "output"
  116126. },
  116127. "connections": {
  116128. "C": [ 42 ],
  116129. "D": [ 2960 ],
  116130. "E": [ 3995 ],
  116131. "Q": [ 3147 ]
  116132. }
  116133. },
  116134. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_7": {
  116135. "hide_name": 0,
  116136. "type": "SB_DFFE",
  116137. "parameters": {
  116138. },
  116139. "attributes": {
  116140. "module_not_derived": "00000000000000000000000000000001",
  116141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116142. },
  116143. "port_directions": {
  116144. "C": "input",
  116145. "D": "input",
  116146. "E": "input",
  116147. "Q": "output"
  116148. },
  116149. "connections": {
  116150. "C": [ 42 ],
  116151. "D": [ 2957 ],
  116152. "E": [ 3995 ],
  116153. "Q": [ 3140 ]
  116154. }
  116155. },
  116156. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_8": {
  116157. "hide_name": 0,
  116158. "type": "SB_DFFE",
  116159. "parameters": {
  116160. },
  116161. "attributes": {
  116162. "module_not_derived": "00000000000000000000000000000001",
  116163. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116164. },
  116165. "port_directions": {
  116166. "C": "input",
  116167. "D": "input",
  116168. "E": "input",
  116169. "Q": "output"
  116170. },
  116171. "connections": {
  116172. "C": [ 42 ],
  116173. "D": [ 2945 ],
  116174. "E": [ 3995 ],
  116175. "Q": [ 3216 ]
  116176. }
  116177. },
  116178. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA_SB_DFFE_Q_9": {
  116179. "hide_name": 0,
  116180. "type": "SB_DFFE",
  116181. "parameters": {
  116182. },
  116183. "attributes": {
  116184. "module_not_derived": "00000000000000000000000000000001",
  116185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116186. },
  116187. "port_directions": {
  116188. "C": "input",
  116189. "D": "input",
  116190. "E": "input",
  116191. "Q": "output"
  116192. },
  116193. "connections": {
  116194. "C": [ 42 ],
  116195. "D": [ 2942 ],
  116196. "E": [ 3995 ],
  116197. "Q": [ 3133 ]
  116198. }
  116199. },
  116200. "cpu_I.execute_to_memory_REGFILE_WRITE_VALID_SB_DFFE_Q": {
  116201. "hide_name": 0,
  116202. "type": "SB_DFFE",
  116203. "parameters": {
  116204. },
  116205. "attributes": {
  116206. "module_not_derived": "00000000000000000000000000000001",
  116207. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116208. },
  116209. "port_directions": {
  116210. "C": "input",
  116211. "D": "input",
  116212. "E": "input",
  116213. "Q": "output"
  116214. },
  116215. "connections": {
  116216. "C": [ 42 ],
  116217. "D": [ 4268 ],
  116218. "E": [ 3995 ],
  116219. "Q": [ 4895 ]
  116220. }
  116221. },
  116222. "cpu_I.execute_to_memory_SHIFT_CTRL_SB_DFFE_Q": {
  116223. "hide_name": 0,
  116224. "type": "SB_DFFE",
  116225. "parameters": {
  116226. },
  116227. "attributes": {
  116228. "module_not_derived": "00000000000000000000000000000001",
  116229. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116230. },
  116231. "port_directions": {
  116232. "C": "input",
  116233. "D": "input",
  116234. "E": "input",
  116235. "Q": "output"
  116236. },
  116237. "connections": {
  116238. "C": [ 42 ],
  116239. "D": [ 4277 ],
  116240. "E": [ 3995 ],
  116241. "Q": [ 3095 ]
  116242. }
  116243. },
  116244. "cpu_I.execute_to_memory_SHIFT_CTRL_SB_DFFE_Q_1": {
  116245. "hide_name": 0,
  116246. "type": "SB_DFFE",
  116247. "parameters": {
  116248. },
  116249. "attributes": {
  116250. "module_not_derived": "00000000000000000000000000000001",
  116251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116252. },
  116253. "port_directions": {
  116254. "C": "input",
  116255. "D": "input",
  116256. "E": "input",
  116257. "Q": "output"
  116258. },
  116259. "connections": {
  116260. "C": [ 42 ],
  116261. "D": [ 4278 ],
  116262. "E": [ 3995 ],
  116263. "Q": [ 3096 ]
  116264. }
  116265. },
  116266. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q": {
  116267. "hide_name": 0,
  116268. "type": "SB_DFFE",
  116269. "parameters": {
  116270. },
  116271. "attributes": {
  116272. "module_not_derived": "00000000000000000000000000000001",
  116273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116274. },
  116275. "port_directions": {
  116276. "C": "input",
  116277. "D": "input",
  116278. "E": "input",
  116279. "Q": "output"
  116280. },
  116281. "connections": {
  116282. "C": [ 42 ],
  116283. "D": [ 2409 ],
  116284. "E": [ 3995 ],
  116285. "Q": [ 3175 ]
  116286. }
  116287. },
  116288. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_1": {
  116289. "hide_name": 0,
  116290. "type": "SB_DFFE",
  116291. "parameters": {
  116292. },
  116293. "attributes": {
  116294. "module_not_derived": "00000000000000000000000000000001",
  116295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116296. },
  116297. "port_directions": {
  116298. "C": "input",
  116299. "D": "input",
  116300. "E": "input",
  116301. "Q": "output"
  116302. },
  116303. "connections": {
  116304. "C": [ 42 ],
  116305. "D": [ 2413 ],
  116306. "E": [ 3995 ],
  116307. "Q": [ 3192 ]
  116308. }
  116309. },
  116310. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_10": {
  116311. "hide_name": 0,
  116312. "type": "SB_DFFE",
  116313. "parameters": {
  116314. },
  116315. "attributes": {
  116316. "module_not_derived": "00000000000000000000000000000001",
  116317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116318. },
  116319. "port_directions": {
  116320. "C": "input",
  116321. "D": "input",
  116322. "E": "input",
  116323. "Q": "output"
  116324. },
  116325. "connections": {
  116326. "C": [ 42 ],
  116327. "D": [ 2438 ],
  116328. "E": [ 3995 ],
  116329. "Q": [ 3225 ]
  116330. }
  116331. },
  116332. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_11": {
  116333. "hide_name": 0,
  116334. "type": "SB_DFFE",
  116335. "parameters": {
  116336. },
  116337. "attributes": {
  116338. "module_not_derived": "00000000000000000000000000000001",
  116339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116340. },
  116341. "port_directions": {
  116342. "C": "input",
  116343. "D": "input",
  116344. "E": "input",
  116345. "Q": "output"
  116346. },
  116347. "connections": {
  116348. "C": [ 42 ],
  116349. "D": [ 2440 ],
  116350. "E": [ 3995 ],
  116351. "Q": [ 3128 ]
  116352. }
  116353. },
  116354. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_12": {
  116355. "hide_name": 0,
  116356. "type": "SB_DFFE",
  116357. "parameters": {
  116358. },
  116359. "attributes": {
  116360. "module_not_derived": "00000000000000000000000000000001",
  116361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116362. },
  116363. "port_directions": {
  116364. "C": "input",
  116365. "D": "input",
  116366. "E": "input",
  116367. "Q": "output"
  116368. },
  116369. "connections": {
  116370. "C": [ 42 ],
  116371. "D": [ 2445 ],
  116372. "E": [ 3995 ],
  116373. "Q": [ 3121 ]
  116374. }
  116375. },
  116376. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_13": {
  116377. "hide_name": 0,
  116378. "type": "SB_DFFE",
  116379. "parameters": {
  116380. },
  116381. "attributes": {
  116382. "module_not_derived": "00000000000000000000000000000001",
  116383. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116384. },
  116385. "port_directions": {
  116386. "C": "input",
  116387. "D": "input",
  116388. "E": "input",
  116389. "Q": "output"
  116390. },
  116391. "connections": {
  116392. "C": [ 42 ],
  116393. "D": [ 2446 ],
  116394. "E": [ 3995 ],
  116395. "Q": [ 3114 ]
  116396. }
  116397. },
  116398. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_14": {
  116399. "hide_name": 0,
  116400. "type": "SB_DFFE",
  116401. "parameters": {
  116402. },
  116403. "attributes": {
  116404. "module_not_derived": "00000000000000000000000000000001",
  116405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116406. },
  116407. "port_directions": {
  116408. "C": "input",
  116409. "D": "input",
  116410. "E": "input",
  116411. "Q": "output"
  116412. },
  116413. "connections": {
  116414. "C": [ 42 ],
  116415. "D": [ 2447 ],
  116416. "E": [ 3995 ],
  116417. "Q": [ 3107 ]
  116418. }
  116419. },
  116420. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_15": {
  116421. "hide_name": 0,
  116422. "type": "SB_DFFE",
  116423. "parameters": {
  116424. },
  116425. "attributes": {
  116426. "module_not_derived": "00000000000000000000000000000001",
  116427. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116428. },
  116429. "port_directions": {
  116430. "C": "input",
  116431. "D": "input",
  116432. "E": "input",
  116433. "Q": "output"
  116434. },
  116435. "connections": {
  116436. "C": [ 42 ],
  116437. "D": [ 2448 ],
  116438. "E": [ 3995 ],
  116439. "Q": [ 3093 ]
  116440. }
  116441. },
  116442. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_16": {
  116443. "hide_name": 0,
  116444. "type": "SB_DFFE",
  116445. "parameters": {
  116446. },
  116447. "attributes": {
  116448. "module_not_derived": "00000000000000000000000000000001",
  116449. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116450. },
  116451. "port_directions": {
  116452. "C": "input",
  116453. "D": "input",
  116454. "E": "input",
  116455. "Q": "output"
  116456. },
  116457. "connections": {
  116458. "C": [ 42 ],
  116459. "D": [ 2402 ],
  116460. "E": [ 3995 ],
  116461. "Q": [ 3094 ]
  116462. }
  116463. },
  116464. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_17": {
  116465. "hide_name": 0,
  116466. "type": "SB_DFFE",
  116467. "parameters": {
  116468. },
  116469. "attributes": {
  116470. "module_not_derived": "00000000000000000000000000000001",
  116471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116472. },
  116473. "port_directions": {
  116474. "C": "input",
  116475. "D": "input",
  116476. "E": "input",
  116477. "Q": "output"
  116478. },
  116479. "connections": {
  116480. "C": [ 42 ],
  116481. "D": [ 2478 ],
  116482. "E": [ 3995 ],
  116483. "Q": [ 3108 ]
  116484. }
  116485. },
  116486. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_18": {
  116487. "hide_name": 0,
  116488. "type": "SB_DFFE",
  116489. "parameters": {
  116490. },
  116491. "attributes": {
  116492. "module_not_derived": "00000000000000000000000000000001",
  116493. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116494. },
  116495. "port_directions": {
  116496. "C": "input",
  116497. "D": "input",
  116498. "E": "input",
  116499. "Q": "output"
  116500. },
  116501. "connections": {
  116502. "C": [ 42 ],
  116503. "D": [ 2358 ],
  116504. "E": [ 3995 ],
  116505. "Q": [ 3115 ]
  116506. }
  116507. },
  116508. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_19": {
  116509. "hide_name": 0,
  116510. "type": "SB_DFFE",
  116511. "parameters": {
  116512. },
  116513. "attributes": {
  116514. "module_not_derived": "00000000000000000000000000000001",
  116515. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116516. },
  116517. "port_directions": {
  116518. "C": "input",
  116519. "D": "input",
  116520. "E": "input",
  116521. "Q": "output"
  116522. },
  116523. "connections": {
  116524. "C": [ 42 ],
  116525. "D": [ 2483 ],
  116526. "E": [ 3995 ],
  116527. "Q": [ 3122 ]
  116528. }
  116529. },
  116530. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_2": {
  116531. "hide_name": 0,
  116532. "type": "SB_DFFE",
  116533. "parameters": {
  116534. },
  116535. "attributes": {
  116536. "module_not_derived": "00000000000000000000000000000001",
  116537. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116538. },
  116539. "port_directions": {
  116540. "C": "input",
  116541. "D": "input",
  116542. "E": "input",
  116543. "Q": "output"
  116544. },
  116545. "connections": {
  116546. "C": [ 42 ],
  116547. "D": [ 2414 ],
  116548. "E": [ 3995 ],
  116549. "Q": [ 3199 ]
  116550. }
  116551. },
  116552. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_20": {
  116553. "hide_name": 0,
  116554. "type": "SB_DFFE",
  116555. "parameters": {
  116556. },
  116557. "attributes": {
  116558. "module_not_derived": "00000000000000000000000000000001",
  116559. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116560. },
  116561. "port_directions": {
  116562. "C": "input",
  116563. "D": "input",
  116564. "E": "input",
  116565. "Q": "output"
  116566. },
  116567. "connections": {
  116568. "C": [ 42 ],
  116569. "D": [ 2355 ],
  116570. "E": [ 3995 ],
  116571. "Q": [ 3129 ]
  116572. }
  116573. },
  116574. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_21": {
  116575. "hide_name": 0,
  116576. "type": "SB_DFFE",
  116577. "parameters": {
  116578. },
  116579. "attributes": {
  116580. "module_not_derived": "00000000000000000000000000000001",
  116581. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116582. },
  116583. "port_directions": {
  116584. "C": "input",
  116585. "D": "input",
  116586. "E": "input",
  116587. "Q": "output"
  116588. },
  116589. "connections": {
  116590. "C": [ 42 ],
  116591. "D": [ 2571 ],
  116592. "E": [ 3995 ],
  116593. "Q": [ 3226 ]
  116594. }
  116595. },
  116596. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_22": {
  116597. "hide_name": 0,
  116598. "type": "SB_DFFE",
  116599. "parameters": {
  116600. },
  116601. "attributes": {
  116602. "module_not_derived": "00000000000000000000000000000001",
  116603. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116604. },
  116605. "port_directions": {
  116606. "C": "input",
  116607. "D": "input",
  116608. "E": "input",
  116609. "Q": "output"
  116610. },
  116611. "connections": {
  116612. "C": [ 42 ],
  116613. "D": [ 2568 ],
  116614. "E": [ 3995 ],
  116615. "Q": [ 3136 ]
  116616. }
  116617. },
  116618. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_23": {
  116619. "hide_name": 0,
  116620. "type": "SB_DFFE",
  116621. "parameters": {
  116622. },
  116623. "attributes": {
  116624. "module_not_derived": "00000000000000000000000000000001",
  116625. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116626. },
  116627. "port_directions": {
  116628. "C": "input",
  116629. "D": "input",
  116630. "E": "input",
  116631. "Q": "output"
  116632. },
  116633. "connections": {
  116634. "C": [ 42 ],
  116635. "D": [ 2559 ],
  116636. "E": [ 3995 ],
  116637. "Q": [ 3219 ]
  116638. }
  116639. },
  116640. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_24": {
  116641. "hide_name": 0,
  116642. "type": "SB_DFFE",
  116643. "parameters": {
  116644. },
  116645. "attributes": {
  116646. "module_not_derived": "00000000000000000000000000000001",
  116647. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116648. },
  116649. "port_directions": {
  116650. "C": "input",
  116651. "D": "input",
  116652. "E": "input",
  116653. "Q": "output"
  116654. },
  116655. "connections": {
  116656. "C": [ 42 ],
  116657. "D": [ 2556 ],
  116658. "E": [ 3995 ],
  116659. "Q": [ 3143 ]
  116660. }
  116661. },
  116662. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_25": {
  116663. "hide_name": 0,
  116664. "type": "SB_DFFE",
  116665. "parameters": {
  116666. },
  116667. "attributes": {
  116668. "module_not_derived": "00000000000000000000000000000001",
  116669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116670. },
  116671. "port_directions": {
  116672. "C": "input",
  116673. "D": "input",
  116674. "E": "input",
  116675. "Q": "output"
  116676. },
  116677. "connections": {
  116678. "C": [ 42 ],
  116679. "D": [ 2548 ],
  116680. "E": [ 3995 ],
  116681. "Q": [ 3150 ]
  116682. }
  116683. },
  116684. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_26": {
  116685. "hide_name": 0,
  116686. "type": "SB_DFFE",
  116687. "parameters": {
  116688. },
  116689. "attributes": {
  116690. "module_not_derived": "00000000000000000000000000000001",
  116691. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116692. },
  116693. "port_directions": {
  116694. "C": "input",
  116695. "D": "input",
  116696. "E": "input",
  116697. "Q": "output"
  116698. },
  116699. "connections": {
  116700. "C": [ 42 ],
  116701. "D": [ 2514 ],
  116702. "E": [ 3995 ],
  116703. "Q": [ 3157 ]
  116704. }
  116705. },
  116706. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_27": {
  116707. "hide_name": 0,
  116708. "type": "SB_DFFE",
  116709. "parameters": {
  116710. },
  116711. "attributes": {
  116712. "module_not_derived": "00000000000000000000000000000001",
  116713. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116714. },
  116715. "port_directions": {
  116716. "C": "input",
  116717. "D": "input",
  116718. "E": "input",
  116719. "Q": "output"
  116720. },
  116721. "connections": {
  116722. "C": [ 42 ],
  116723. "D": [ 2476 ],
  116724. "E": [ 3995 ],
  116725. "Q": [ 3161 ]
  116726. }
  116727. },
  116728. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_28": {
  116729. "hide_name": 0,
  116730. "type": "SB_DFFE",
  116731. "parameters": {
  116732. },
  116733. "attributes": {
  116734. "module_not_derived": "00000000000000000000000000000001",
  116735. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116736. },
  116737. "port_directions": {
  116738. "C": "input",
  116739. "D": "input",
  116740. "E": "input",
  116741. "Q": "output"
  116742. },
  116743. "connections": {
  116744. "C": [ 42 ],
  116745. "D": [ 2430 ],
  116746. "E": [ 3995 ],
  116747. "Q": [ 3212 ]
  116748. }
  116749. },
  116750. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_29": {
  116751. "hide_name": 0,
  116752. "type": "SB_DFFE",
  116753. "parameters": {
  116754. },
  116755. "attributes": {
  116756. "module_not_derived": "00000000000000000000000000000001",
  116757. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116758. },
  116759. "port_directions": {
  116760. "C": "input",
  116761. "D": "input",
  116762. "E": "input",
  116763. "Q": "output"
  116764. },
  116765. "connections": {
  116766. "C": [ 42 ],
  116767. "D": [ 2352 ],
  116768. "E": [ 3995 ],
  116769. "Q": [ 3200 ]
  116770. }
  116771. },
  116772. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_3": {
  116773. "hide_name": 0,
  116774. "type": "SB_DFFE",
  116775. "parameters": {
  116776. },
  116777. "attributes": {
  116778. "module_not_derived": "00000000000000000000000000000001",
  116779. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116780. },
  116781. "port_directions": {
  116782. "C": "input",
  116783. "D": "input",
  116784. "E": "input",
  116785. "Q": "output"
  116786. },
  116787. "connections": {
  116788. "C": [ 42 ],
  116789. "D": [ 2417 ],
  116790. "E": [ 3995 ],
  116791. "Q": [ 3211 ]
  116792. }
  116793. },
  116794. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_30": {
  116795. "hide_name": 0,
  116796. "type": "SB_DFFE",
  116797. "parameters": {
  116798. },
  116799. "attributes": {
  116800. "module_not_derived": "00000000000000000000000000000001",
  116801. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116802. },
  116803. "port_directions": {
  116804. "C": "input",
  116805. "D": "input",
  116806. "E": "input",
  116807. "Q": "output"
  116808. },
  116809. "connections": {
  116810. "C": [ 42 ],
  116811. "D": [ 2444 ],
  116812. "E": [ 3995 ],
  116813. "Q": [ 3193 ]
  116814. }
  116815. },
  116816. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_31": {
  116817. "hide_name": 0,
  116818. "type": "SB_DFFE",
  116819. "parameters": {
  116820. },
  116821. "attributes": {
  116822. "module_not_derived": "00000000000000000000000000000001",
  116823. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116824. },
  116825. "port_directions": {
  116826. "C": "input",
  116827. "D": "input",
  116828. "E": "input",
  116829. "Q": "output"
  116830. },
  116831. "connections": {
  116832. "C": [ 42 ],
  116833. "D": [ 2348 ],
  116834. "E": [ 3995 ],
  116835. "Q": [ 3176 ]
  116836. }
  116837. },
  116838. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_4": {
  116839. "hide_name": 0,
  116840. "type": "SB_DFFE",
  116841. "parameters": {
  116842. },
  116843. "attributes": {
  116844. "module_not_derived": "00000000000000000000000000000001",
  116845. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116846. },
  116847. "port_directions": {
  116848. "C": "input",
  116849. "D": "input",
  116850. "E": "input",
  116851. "Q": "output"
  116852. },
  116853. "connections": {
  116854. "C": [ 42 ],
  116855. "D": [ 2418 ],
  116856. "E": [ 3995 ],
  116857. "Q": [ 3160 ]
  116858. }
  116859. },
  116860. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_5": {
  116861. "hide_name": 0,
  116862. "type": "SB_DFFE",
  116863. "parameters": {
  116864. },
  116865. "attributes": {
  116866. "module_not_derived": "00000000000000000000000000000001",
  116867. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116868. },
  116869. "port_directions": {
  116870. "C": "input",
  116871. "D": "input",
  116872. "E": "input",
  116873. "Q": "output"
  116874. },
  116875. "connections": {
  116876. "C": [ 42 ],
  116877. "D": [ 2425 ],
  116878. "E": [ 3995 ],
  116879. "Q": [ 3156 ]
  116880. }
  116881. },
  116882. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_6": {
  116883. "hide_name": 0,
  116884. "type": "SB_DFFE",
  116885. "parameters": {
  116886. },
  116887. "attributes": {
  116888. "module_not_derived": "00000000000000000000000000000001",
  116889. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116890. },
  116891. "port_directions": {
  116892. "C": "input",
  116893. "D": "input",
  116894. "E": "input",
  116895. "Q": "output"
  116896. },
  116897. "connections": {
  116898. "C": [ 42 ],
  116899. "D": [ 2427 ],
  116900. "E": [ 3995 ],
  116901. "Q": [ 3149 ]
  116902. }
  116903. },
  116904. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_7": {
  116905. "hide_name": 0,
  116906. "type": "SB_DFFE",
  116907. "parameters": {
  116908. },
  116909. "attributes": {
  116910. "module_not_derived": "00000000000000000000000000000001",
  116911. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116912. },
  116913. "port_directions": {
  116914. "C": "input",
  116915. "D": "input",
  116916. "E": "input",
  116917. "Q": "output"
  116918. },
  116919. "connections": {
  116920. "C": [ 42 ],
  116921. "D": [ 2432 ],
  116922. "E": [ 3995 ],
  116923. "Q": [ 3142 ]
  116924. }
  116925. },
  116926. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_8": {
  116927. "hide_name": 0,
  116928. "type": "SB_DFFE",
  116929. "parameters": {
  116930. },
  116931. "attributes": {
  116932. "module_not_derived": "00000000000000000000000000000001",
  116933. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116934. },
  116935. "port_directions": {
  116936. "C": "input",
  116937. "D": "input",
  116938. "E": "input",
  116939. "Q": "output"
  116940. },
  116941. "connections": {
  116942. "C": [ 42 ],
  116943. "D": [ 2434 ],
  116944. "E": [ 3995 ],
  116945. "Q": [ 3218 ]
  116946. }
  116947. },
  116948. "cpu_I.execute_to_memory_SHIFT_RIGHT_SB_DFFE_Q_9": {
  116949. "hide_name": 0,
  116950. "type": "SB_DFFE",
  116951. "parameters": {
  116952. },
  116953. "attributes": {
  116954. "module_not_derived": "00000000000000000000000000000001",
  116955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  116956. },
  116957. "port_directions": {
  116958. "C": "input",
  116959. "D": "input",
  116960. "E": "input",
  116961. "Q": "output"
  116962. },
  116963. "connections": {
  116964. "C": [ 42 ],
  116965. "D": [ 2436 ],
  116966. "E": [ 3995 ],
  116967. "Q": [ 3135 ]
  116968. }
  116969. },
  116970. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q": {
  116971. "hide_name": 0,
  116972. "type": "SB_DFFESR",
  116973. "parameters": {
  116974. },
  116975. "attributes": {
  116976. "module_not_derived": "00000000000000000000000000000001",
  116977. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  116978. },
  116979. "port_directions": {
  116980. "C": "input",
  116981. "D": "input",
  116982. "E": "input",
  116983. "Q": "output",
  116984. "R": "input"
  116985. },
  116986. "connections": {
  116987. "C": [ 42 ],
  116988. "D": [ 5088 ],
  116989. "E": [ 5089 ],
  116990. "Q": [ 2751 ],
  116991. "R": [ 3995 ]
  116992. }
  116993. },
  116994. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_1": {
  116995. "hide_name": 0,
  116996. "type": "SB_DFFESR",
  116997. "parameters": {
  116998. },
  116999. "attributes": {
  117000. "module_not_derived": "00000000000000000000000000000001",
  117001. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117002. },
  117003. "port_directions": {
  117004. "C": "input",
  117005. "D": "input",
  117006. "E": "input",
  117007. "Q": "output",
  117008. "R": "input"
  117009. },
  117010. "connections": {
  117011. "C": [ 42 ],
  117012. "D": [ 5090 ],
  117013. "E": [ 5089 ],
  117014. "Q": [ 2679 ],
  117015. "R": [ 3995 ]
  117016. }
  117017. },
  117018. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_10": {
  117019. "hide_name": 0,
  117020. "type": "SB_DFFESR",
  117021. "parameters": {
  117022. },
  117023. "attributes": {
  117024. "module_not_derived": "00000000000000000000000000000001",
  117025. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117026. },
  117027. "port_directions": {
  117028. "C": "input",
  117029. "D": "input",
  117030. "E": "input",
  117031. "Q": "output",
  117032. "R": "input"
  117033. },
  117034. "connections": {
  117035. "C": [ 42 ],
  117036. "D": [ 5091 ],
  117037. "E": [ 5089 ],
  117038. "Q": [ 2620 ],
  117039. "R": [ 3995 ]
  117040. }
  117041. },
  117042. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_11": {
  117043. "hide_name": 0,
  117044. "type": "SB_DFFESR",
  117045. "parameters": {
  117046. },
  117047. "attributes": {
  117048. "module_not_derived": "00000000000000000000000000000001",
  117049. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117050. },
  117051. "port_directions": {
  117052. "C": "input",
  117053. "D": "input",
  117054. "E": "input",
  117055. "Q": "output",
  117056. "R": "input"
  117057. },
  117058. "connections": {
  117059. "C": [ 42 ],
  117060. "D": [ 5092 ],
  117061. "E": [ 5089 ],
  117062. "Q": [ 2615 ],
  117063. "R": [ 3995 ]
  117064. }
  117065. },
  117066. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_12": {
  117067. "hide_name": 0,
  117068. "type": "SB_DFFESR",
  117069. "parameters": {
  117070. },
  117071. "attributes": {
  117072. "module_not_derived": "00000000000000000000000000000001",
  117073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117074. },
  117075. "port_directions": {
  117076. "C": "input",
  117077. "D": "input",
  117078. "E": "input",
  117079. "Q": "output",
  117080. "R": "input"
  117081. },
  117082. "connections": {
  117083. "C": [ 42 ],
  117084. "D": [ 5093 ],
  117085. "E": [ 5089 ],
  117086. "Q": [ 2610 ],
  117087. "R": [ 3995 ]
  117088. }
  117089. },
  117090. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_13": {
  117091. "hide_name": 0,
  117092. "type": "SB_DFFESR",
  117093. "parameters": {
  117094. },
  117095. "attributes": {
  117096. "module_not_derived": "00000000000000000000000000000001",
  117097. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117098. },
  117099. "port_directions": {
  117100. "C": "input",
  117101. "D": "input",
  117102. "E": "input",
  117103. "Q": "output",
  117104. "R": "input"
  117105. },
  117106. "connections": {
  117107. "C": [ 42 ],
  117108. "D": [ 5094 ],
  117109. "E": [ 5089 ],
  117110. "Q": [ 2601 ],
  117111. "R": [ 3995 ]
  117112. }
  117113. },
  117114. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_14": {
  117115. "hide_name": 0,
  117116. "type": "SB_DFFESR",
  117117. "parameters": {
  117118. },
  117119. "attributes": {
  117120. "module_not_derived": "00000000000000000000000000000001",
  117121. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117122. },
  117123. "port_directions": {
  117124. "C": "input",
  117125. "D": "input",
  117126. "E": "input",
  117127. "Q": "output",
  117128. "R": "input"
  117129. },
  117130. "connections": {
  117131. "C": [ 42 ],
  117132. "D": [ 5095 ],
  117133. "E": [ 5089 ],
  117134. "Q": [ 2749 ],
  117135. "R": [ 3995 ]
  117136. }
  117137. },
  117138. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_15": {
  117139. "hide_name": 0,
  117140. "type": "SB_DFFESR",
  117141. "parameters": {
  117142. },
  117143. "attributes": {
  117144. "module_not_derived": "00000000000000000000000000000001",
  117145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117146. },
  117147. "port_directions": {
  117148. "C": "input",
  117149. "D": "input",
  117150. "E": "input",
  117151. "Q": "output",
  117152. "R": "input"
  117153. },
  117154. "connections": {
  117155. "C": [ 42 ],
  117156. "D": [ 5096 ],
  117157. "E": [ 5089 ],
  117158. "Q": [ 2746 ],
  117159. "R": [ 3995 ]
  117160. }
  117161. },
  117162. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_16": {
  117163. "hide_name": 0,
  117164. "type": "SB_DFFESR",
  117165. "parameters": {
  117166. },
  117167. "attributes": {
  117168. "module_not_derived": "00000000000000000000000000000001",
  117169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117170. },
  117171. "port_directions": {
  117172. "C": "input",
  117173. "D": "input",
  117174. "E": "input",
  117175. "Q": "output",
  117176. "R": "input"
  117177. },
  117178. "connections": {
  117179. "C": [ 42 ],
  117180. "D": [ 5097 ],
  117181. "E": [ 5089 ],
  117182. "Q": [ 2741 ],
  117183. "R": [ 3995 ]
  117184. }
  117185. },
  117186. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_17": {
  117187. "hide_name": 0,
  117188. "type": "SB_DFFESR",
  117189. "parameters": {
  117190. },
  117191. "attributes": {
  117192. "module_not_derived": "00000000000000000000000000000001",
  117193. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117194. },
  117195. "port_directions": {
  117196. "C": "input",
  117197. "D": "input",
  117198. "E": "input",
  117199. "Q": "output",
  117200. "R": "input"
  117201. },
  117202. "connections": {
  117203. "C": [ 42 ],
  117204. "D": [ 5098 ],
  117205. "E": [ 5089 ],
  117206. "Q": [ 2736 ],
  117207. "R": [ 3995 ]
  117208. }
  117209. },
  117210. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_18": {
  117211. "hide_name": 0,
  117212. "type": "SB_DFFESR",
  117213. "parameters": {
  117214. },
  117215. "attributes": {
  117216. "module_not_derived": "00000000000000000000000000000001",
  117217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117218. },
  117219. "port_directions": {
  117220. "C": "input",
  117221. "D": "input",
  117222. "E": "input",
  117223. "Q": "output",
  117224. "R": "input"
  117225. },
  117226. "connections": {
  117227. "C": [ 42 ],
  117228. "D": [ 5099 ],
  117229. "E": [ 5089 ],
  117230. "Q": [ 2731 ],
  117231. "R": [ 3995 ]
  117232. }
  117233. },
  117234. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_19": {
  117235. "hide_name": 0,
  117236. "type": "SB_DFFESR",
  117237. "parameters": {
  117238. },
  117239. "attributes": {
  117240. "module_not_derived": "00000000000000000000000000000001",
  117241. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117242. },
  117243. "port_directions": {
  117244. "C": "input",
  117245. "D": "input",
  117246. "E": "input",
  117247. "Q": "output",
  117248. "R": "input"
  117249. },
  117250. "connections": {
  117251. "C": [ 42 ],
  117252. "D": [ 5100 ],
  117253. "E": [ 5089 ],
  117254. "Q": [ 2726 ],
  117255. "R": [ 3995 ]
  117256. }
  117257. },
  117258. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_2": {
  117259. "hide_name": 0,
  117260. "type": "SB_DFFESR",
  117261. "parameters": {
  117262. },
  117263. "attributes": {
  117264. "module_not_derived": "00000000000000000000000000000001",
  117265. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117266. },
  117267. "port_directions": {
  117268. "C": "input",
  117269. "D": "input",
  117270. "E": "input",
  117271. "Q": "output",
  117272. "R": "input"
  117273. },
  117274. "connections": {
  117275. "C": [ 42 ],
  117276. "D": [ 5101 ],
  117277. "E": [ 5089 ],
  117278. "Q": [ 2674 ],
  117279. "R": [ 3995 ]
  117280. }
  117281. },
  117282. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_20": {
  117283. "hide_name": 0,
  117284. "type": "SB_DFFESR",
  117285. "parameters": {
  117286. },
  117287. "attributes": {
  117288. "module_not_derived": "00000000000000000000000000000001",
  117289. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117290. },
  117291. "port_directions": {
  117292. "C": "input",
  117293. "D": "input",
  117294. "E": "input",
  117295. "Q": "output",
  117296. "R": "input"
  117297. },
  117298. "connections": {
  117299. "C": [ 42 ],
  117300. "D": [ 5102 ],
  117301. "E": [ 5089 ],
  117302. "Q": [ 2721 ],
  117303. "R": [ 3995 ]
  117304. }
  117305. },
  117306. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_21": {
  117307. "hide_name": 0,
  117308. "type": "SB_DFFESR",
  117309. "parameters": {
  117310. },
  117311. "attributes": {
  117312. "module_not_derived": "00000000000000000000000000000001",
  117313. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117314. },
  117315. "port_directions": {
  117316. "C": "input",
  117317. "D": "input",
  117318. "E": "input",
  117319. "Q": "output",
  117320. "R": "input"
  117321. },
  117322. "connections": {
  117323. "C": [ 42 ],
  117324. "D": [ 5103 ],
  117325. "E": [ 5089 ],
  117326. "Q": [ 2711 ],
  117327. "R": [ 3995 ]
  117328. }
  117329. },
  117330. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_22": {
  117331. "hide_name": 0,
  117332. "type": "SB_DFFESR",
  117333. "parameters": {
  117334. },
  117335. "attributes": {
  117336. "module_not_derived": "00000000000000000000000000000001",
  117337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117338. },
  117339. "port_directions": {
  117340. "C": "input",
  117341. "D": "input",
  117342. "E": "input",
  117343. "Q": "output",
  117344. "R": "input"
  117345. },
  117346. "connections": {
  117347. "C": [ 42 ],
  117348. "D": [ 5104 ],
  117349. "E": [ 5089 ],
  117350. "Q": [ 2652 ],
  117351. "R": [ 3995 ]
  117352. }
  117353. },
  117354. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_23": {
  117355. "hide_name": 0,
  117356. "type": "SB_DFFESR",
  117357. "parameters": {
  117358. },
  117359. "attributes": {
  117360. "module_not_derived": "00000000000000000000000000000001",
  117361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117362. },
  117363. "port_directions": {
  117364. "C": "input",
  117365. "D": "input",
  117366. "E": "input",
  117367. "Q": "output",
  117368. "R": "input"
  117369. },
  117370. "connections": {
  117371. "C": [ 42 ],
  117372. "D": [ 5105 ],
  117373. "E": [ 5089 ],
  117374. "Q": [ 2717 ],
  117375. "R": [ 3995 ]
  117376. }
  117377. },
  117378. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_24": {
  117379. "hide_name": 0,
  117380. "type": "SB_DFFESR",
  117381. "parameters": {
  117382. },
  117383. "attributes": {
  117384. "module_not_derived": "00000000000000000000000000000001",
  117385. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117386. },
  117387. "port_directions": {
  117388. "C": "input",
  117389. "D": "input",
  117390. "E": "input",
  117391. "Q": "output",
  117392. "R": "input"
  117393. },
  117394. "connections": {
  117395. "C": [ 42 ],
  117396. "D": [ 5106 ],
  117397. "E": [ 5089 ],
  117398. "Q": [ 2709 ],
  117399. "R": [ 3995 ]
  117400. }
  117401. },
  117402. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_25": {
  117403. "hide_name": 0,
  117404. "type": "SB_DFFESR",
  117405. "parameters": {
  117406. },
  117407. "attributes": {
  117408. "module_not_derived": "00000000000000000000000000000001",
  117409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117410. },
  117411. "port_directions": {
  117412. "C": "input",
  117413. "D": "input",
  117414. "E": "input",
  117415. "Q": "output",
  117416. "R": "input"
  117417. },
  117418. "connections": {
  117419. "C": [ 42 ],
  117420. "D": [ 5107 ],
  117421. "E": [ 5089 ],
  117422. "Q": [ 2704 ],
  117423. "R": [ 3995 ]
  117424. }
  117425. },
  117426. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_26": {
  117427. "hide_name": 0,
  117428. "type": "SB_DFFESR",
  117429. "parameters": {
  117430. },
  117431. "attributes": {
  117432. "module_not_derived": "00000000000000000000000000000001",
  117433. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117434. },
  117435. "port_directions": {
  117436. "C": "input",
  117437. "D": "input",
  117438. "E": "input",
  117439. "Q": "output",
  117440. "R": "input"
  117441. },
  117442. "connections": {
  117443. "C": [ 42 ],
  117444. "D": [ 5108 ],
  117445. "E": [ 5089 ],
  117446. "Q": [ 2699 ],
  117447. "R": [ 3995 ]
  117448. }
  117449. },
  117450. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_27": {
  117451. "hide_name": 0,
  117452. "type": "SB_DFFESR",
  117453. "parameters": {
  117454. },
  117455. "attributes": {
  117456. "module_not_derived": "00000000000000000000000000000001",
  117457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117458. },
  117459. "port_directions": {
  117460. "C": "input",
  117461. "D": "input",
  117462. "E": "input",
  117463. "Q": "output",
  117464. "R": "input"
  117465. },
  117466. "connections": {
  117467. "C": [ 42 ],
  117468. "D": [ 5109 ],
  117469. "E": [ 5089 ],
  117470. "Q": [ 2694 ],
  117471. "R": [ 3995 ]
  117472. }
  117473. },
  117474. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_28": {
  117475. "hide_name": 0,
  117476. "type": "SB_DFFESR",
  117477. "parameters": {
  117478. },
  117479. "attributes": {
  117480. "module_not_derived": "00000000000000000000000000000001",
  117481. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117482. },
  117483. "port_directions": {
  117484. "C": "input",
  117485. "D": "input",
  117486. "E": "input",
  117487. "Q": "output",
  117488. "R": "input"
  117489. },
  117490. "connections": {
  117491. "C": [ 42 ],
  117492. "D": [ 5110 ],
  117493. "E": [ 5089 ],
  117494. "Q": [ 2689 ],
  117495. "R": [ 3995 ]
  117496. }
  117497. },
  117498. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_29": {
  117499. "hide_name": 0,
  117500. "type": "SB_DFFESR",
  117501. "parameters": {
  117502. },
  117503. "attributes": {
  117504. "module_not_derived": "00000000000000000000000000000001",
  117505. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117506. },
  117507. "port_directions": {
  117508. "C": "input",
  117509. "D": "input",
  117510. "E": "input",
  117511. "Q": "output",
  117512. "R": "input"
  117513. },
  117514. "connections": {
  117515. "C": [ 42 ],
  117516. "D": [ 5111 ],
  117517. "E": [ 5089 ],
  117518. "Q": [ 2684 ],
  117519. "R": [ 3995 ]
  117520. }
  117521. },
  117522. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_3": {
  117523. "hide_name": 0,
  117524. "type": "SB_DFFESR",
  117525. "parameters": {
  117526. },
  117527. "attributes": {
  117528. "module_not_derived": "00000000000000000000000000000001",
  117529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117530. },
  117531. "port_directions": {
  117532. "C": "input",
  117533. "D": "input",
  117534. "E": "input",
  117535. "Q": "output",
  117536. "R": "input"
  117537. },
  117538. "connections": {
  117539. "C": [ 42 ],
  117540. "D": [ 5112 ],
  117541. "E": [ 5089 ],
  117542. "Q": [ 2662 ],
  117543. "R": [ 3995 ]
  117544. }
  117545. },
  117546. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_30": {
  117547. "hide_name": 0,
  117548. "type": "SB_DFFESR",
  117549. "parameters": {
  117550. },
  117551. "attributes": {
  117552. "module_not_derived": "00000000000000000000000000000001",
  117553. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117554. },
  117555. "port_directions": {
  117556. "C": "input",
  117557. "D": "input",
  117558. "E": "input",
  117559. "Q": "output",
  117560. "R": "input"
  117561. },
  117562. "connections": {
  117563. "C": [ 42 ],
  117564. "D": [ 5113 ],
  117565. "E": [ 5089 ],
  117566. "Q": [ 2667 ],
  117567. "R": [ 3995 ]
  117568. }
  117569. },
  117570. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_31": {
  117571. "hide_name": 0,
  117572. "type": "SB_DFFESR",
  117573. "parameters": {
  117574. },
  117575. "attributes": {
  117576. "module_not_derived": "00000000000000000000000000000001",
  117577. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117578. },
  117579. "port_directions": {
  117580. "C": "input",
  117581. "D": "input",
  117582. "E": "input",
  117583. "Q": "output",
  117584. "R": "input"
  117585. },
  117586. "connections": {
  117587. "C": [ 42 ],
  117588. "D": [ 5114 ],
  117589. "E": [ 5089 ],
  117590. "Q": [ 2719 ],
  117591. "R": [ 3995 ]
  117592. }
  117593. },
  117594. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_4": {
  117595. "hide_name": 0,
  117596. "type": "SB_DFFESR",
  117597. "parameters": {
  117598. },
  117599. "attributes": {
  117600. "module_not_derived": "00000000000000000000000000000001",
  117601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117602. },
  117603. "port_directions": {
  117604. "C": "input",
  117605. "D": "input",
  117606. "E": "input",
  117607. "Q": "output",
  117608. "R": "input"
  117609. },
  117610. "connections": {
  117611. "C": [ 42 ],
  117612. "D": [ 5115 ],
  117613. "E": [ 5089 ],
  117614. "Q": [ 2650 ],
  117615. "R": [ 3995 ]
  117616. }
  117617. },
  117618. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_5": {
  117619. "hide_name": 0,
  117620. "type": "SB_DFFESR",
  117621. "parameters": {
  117622. },
  117623. "attributes": {
  117624. "module_not_derived": "00000000000000000000000000000001",
  117625. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117626. },
  117627. "port_directions": {
  117628. "C": "input",
  117629. "D": "input",
  117630. "E": "input",
  117631. "Q": "output",
  117632. "R": "input"
  117633. },
  117634. "connections": {
  117635. "C": [ 42 ],
  117636. "D": [ 5116 ],
  117637. "E": [ 5089 ],
  117638. "Q": [ 2645 ],
  117639. "R": [ 3995 ]
  117640. }
  117641. },
  117642. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_6": {
  117643. "hide_name": 0,
  117644. "type": "SB_DFFESR",
  117645. "parameters": {
  117646. },
  117647. "attributes": {
  117648. "module_not_derived": "00000000000000000000000000000001",
  117649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117650. },
  117651. "port_directions": {
  117652. "C": "input",
  117653. "D": "input",
  117654. "E": "input",
  117655. "Q": "output",
  117656. "R": "input"
  117657. },
  117658. "connections": {
  117659. "C": [ 42 ],
  117660. "D": [ 5117 ],
  117661. "E": [ 5089 ],
  117662. "Q": [ 2640 ],
  117663. "R": [ 3995 ]
  117664. }
  117665. },
  117666. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_7": {
  117667. "hide_name": 0,
  117668. "type": "SB_DFFESR",
  117669. "parameters": {
  117670. },
  117671. "attributes": {
  117672. "module_not_derived": "00000000000000000000000000000001",
  117673. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117674. },
  117675. "port_directions": {
  117676. "C": "input",
  117677. "D": "input",
  117678. "E": "input",
  117679. "Q": "output",
  117680. "R": "input"
  117681. },
  117682. "connections": {
  117683. "C": [ 42 ],
  117684. "D": [ 5118 ],
  117685. "E": [ 5089 ],
  117686. "Q": [ 2635 ],
  117687. "R": [ 3995 ]
  117688. }
  117689. },
  117690. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_8": {
  117691. "hide_name": 0,
  117692. "type": "SB_DFFESR",
  117693. "parameters": {
  117694. },
  117695. "attributes": {
  117696. "module_not_derived": "00000000000000000000000000000001",
  117697. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117698. },
  117699. "port_directions": {
  117700. "C": "input",
  117701. "D": "input",
  117702. "E": "input",
  117703. "Q": "output",
  117704. "R": "input"
  117705. },
  117706. "connections": {
  117707. "C": [ 42 ],
  117708. "D": [ 5119 ],
  117709. "E": [ 5089 ],
  117710. "Q": [ 2630 ],
  117711. "R": [ 3995 ]
  117712. }
  117713. },
  117714. "cpu_I.memory_DivPlugin_accumulator_SB_DFFESR_Q_9": {
  117715. "hide_name": 0,
  117716. "type": "SB_DFFESR",
  117717. "parameters": {
  117718. },
  117719. "attributes": {
  117720. "module_not_derived": "00000000000000000000000000000001",
  117721. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  117722. },
  117723. "port_directions": {
  117724. "C": "input",
  117725. "D": "input",
  117726. "E": "input",
  117727. "Q": "output",
  117728. "R": "input"
  117729. },
  117730. "connections": {
  117731. "C": [ 42 ],
  117732. "D": [ 5120 ],
  117733. "E": [ 5089 ],
  117734. "Q": [ 2625 ],
  117735. "R": [ 3995 ]
  117736. }
  117737. },
  117738. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_DFFR_D": {
  117739. "hide_name": 0,
  117740. "type": "SB_DFFR",
  117741. "parameters": {
  117742. },
  117743. "attributes": {
  117744. "module_not_derived": "00000000000000000000000000000001",
  117745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  117746. },
  117747. "port_directions": {
  117748. "C": "input",
  117749. "D": "input",
  117750. "Q": "output",
  117751. "R": "input"
  117752. },
  117753. "connections": {
  117754. "C": [ 42 ],
  117755. "D": [ 5121 ],
  117756. "Q": [ 5122 ],
  117757. "R": [ 127 ]
  117758. }
  117759. },
  117760. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_DFFR_D_1": {
  117761. "hide_name": 0,
  117762. "type": "SB_DFFR",
  117763. "parameters": {
  117764. },
  117765. "attributes": {
  117766. "module_not_derived": "00000000000000000000000000000001",
  117767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  117768. },
  117769. "port_directions": {
  117770. "C": "input",
  117771. "D": "input",
  117772. "Q": "output",
  117773. "R": "input"
  117774. },
  117775. "connections": {
  117776. "C": [ 42 ],
  117777. "D": [ 5123 ],
  117778. "Q": [ 5124 ],
  117779. "R": [ 127 ]
  117780. }
  117781. },
  117782. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_DFFR_D_2": {
  117783. "hide_name": 0,
  117784. "type": "SB_DFFR",
  117785. "parameters": {
  117786. },
  117787. "attributes": {
  117788. "module_not_derived": "00000000000000000000000000000001",
  117789. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  117790. },
  117791. "port_directions": {
  117792. "C": "input",
  117793. "D": "input",
  117794. "Q": "output",
  117795. "R": "input"
  117796. },
  117797. "connections": {
  117798. "C": [ 42 ],
  117799. "D": [ 5125 ],
  117800. "Q": [ 5126 ],
  117801. "R": [ 127 ]
  117802. }
  117803. },
  117804. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_DFFR_D_3": {
  117805. "hide_name": 0,
  117806. "type": "SB_DFFR",
  117807. "parameters": {
  117808. },
  117809. "attributes": {
  117810. "module_not_derived": "00000000000000000000000000000001",
  117811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  117812. },
  117813. "port_directions": {
  117814. "C": "input",
  117815. "D": "input",
  117816. "Q": "output",
  117817. "R": "input"
  117818. },
  117819. "connections": {
  117820. "C": [ 42 ],
  117821. "D": [ 5127 ],
  117822. "Q": [ 5128 ],
  117823. "R": [ 127 ]
  117824. }
  117825. },
  117826. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_DFFR_D_4": {
  117827. "hide_name": 0,
  117828. "type": "SB_DFFR",
  117829. "parameters": {
  117830. },
  117831. "attributes": {
  117832. "module_not_derived": "00000000000000000000000000000001",
  117833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  117834. },
  117835. "port_directions": {
  117836. "C": "input",
  117837. "D": "input",
  117838. "Q": "output",
  117839. "R": "input"
  117840. },
  117841. "connections": {
  117842. "C": [ 42 ],
  117843. "D": [ 5129 ],
  117844. "Q": [ 5130 ],
  117845. "R": [ 127 ]
  117846. }
  117847. },
  117848. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_DFFR_D_5": {
  117849. "hide_name": 0,
  117850. "type": "SB_DFFR",
  117851. "parameters": {
  117852. },
  117853. "attributes": {
  117854. "module_not_derived": "00000000000000000000000000000001",
  117855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  117856. },
  117857. "port_directions": {
  117858. "C": "input",
  117859. "D": "input",
  117860. "Q": "output",
  117861. "R": "input"
  117862. },
  117863. "connections": {
  117864. "C": [ 42 ],
  117865. "D": [ 5131 ],
  117866. "Q": [ 5132 ],
  117867. "R": [ 127 ]
  117868. }
  117869. },
  117870. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O": {
  117871. "hide_name": 0,
  117872. "type": "SB_LUT4",
  117873. "parameters": {
  117874. "LUT_INIT": "0000101010100000"
  117875. },
  117876. "attributes": {
  117877. "module_not_derived": "00000000000000000000000000000001",
  117878. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  117879. },
  117880. "port_directions": {
  117881. "I0": "input",
  117882. "I1": "input",
  117883. "I2": "input",
  117884. "I3": "input",
  117885. "O": "output"
  117886. },
  117887. "connections": {
  117888. "I0": [ 1018 ],
  117889. "I1": [ "0" ],
  117890. "I2": [ 5126 ],
  117891. "I3": [ 5133 ],
  117892. "O": [ 5125 ]
  117893. }
  117894. },
  117895. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_1": {
  117896. "hide_name": 0,
  117897. "type": "SB_LUT4",
  117898. "parameters": {
  117899. "LUT_INIT": "0000101010100000"
  117900. },
  117901. "attributes": {
  117902. "module_not_derived": "00000000000000000000000000000001",
  117903. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  117904. },
  117905. "port_directions": {
  117906. "I0": "input",
  117907. "I1": "input",
  117908. "I2": "input",
  117909. "I3": "input",
  117910. "O": "output"
  117911. },
  117912. "connections": {
  117913. "I0": [ 5134 ],
  117914. "I1": [ "0" ],
  117915. "I2": [ 5122 ],
  117916. "I3": [ 5135 ],
  117917. "O": [ 5121 ]
  117918. }
  117919. },
  117920. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  117921. "hide_name": 0,
  117922. "type": "SB_CARRY",
  117923. "parameters": {
  117924. },
  117925. "attributes": {
  117926. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  117927. },
  117928. "port_directions": {
  117929. "CI": "input",
  117930. "CO": "output",
  117931. "I0": "input",
  117932. "I1": "input"
  117933. },
  117934. "connections": {
  117935. "CI": [ 5136 ],
  117936. "CO": [ 5135 ],
  117937. "I0": [ "0" ],
  117938. "I1": [ 5124 ]
  117939. }
  117940. },
  117941. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_2": {
  117942. "hide_name": 0,
  117943. "type": "SB_LUT4",
  117944. "parameters": {
  117945. "LUT_INIT": "0010100000101000"
  117946. },
  117947. "attributes": {
  117948. "module_not_derived": "00000000000000000000000000000001",
  117949. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  117950. },
  117951. "port_directions": {
  117952. "I0": "input",
  117953. "I1": "input",
  117954. "I2": "input",
  117955. "I3": "input",
  117956. "O": "output"
  117957. },
  117958. "connections": {
  117959. "I0": [ 1018 ],
  117960. "I1": [ 4134 ],
  117961. "I2": [ 5132 ],
  117962. "I3": [ "0" ],
  117963. "O": [ 5131 ]
  117964. }
  117965. },
  117966. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_3": {
  117967. "hide_name": 0,
  117968. "type": "SB_LUT4",
  117969. "parameters": {
  117970. "LUT_INIT": "0000101010100000"
  117971. },
  117972. "attributes": {
  117973. "module_not_derived": "00000000000000000000000000000001",
  117974. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  117975. },
  117976. "port_directions": {
  117977. "I0": "input",
  117978. "I1": "input",
  117979. "I2": "input",
  117980. "I3": "input",
  117981. "O": "output"
  117982. },
  117983. "connections": {
  117984. "I0": [ 5134 ],
  117985. "I1": [ "0" ],
  117986. "I2": [ 5130 ],
  117987. "I3": [ 5137 ],
  117988. "O": [ 5129 ]
  117989. }
  117990. },
  117991. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_3_I0_SB_LUT4_O": {
  117992. "hide_name": 0,
  117993. "type": "SB_LUT4",
  117994. "parameters": {
  117995. "LUT_INIT": "0111111101001100"
  117996. },
  117997. "attributes": {
  117998. "module_not_derived": "00000000000000000000000000000001",
  117999. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  118000. },
  118001. "port_directions": {
  118002. "I0": "input",
  118003. "I1": "input",
  118004. "I2": "input",
  118005. "I3": "input",
  118006. "O": "output"
  118007. },
  118008. "connections": {
  118009. "I0": [ 5132 ],
  118010. "I1": [ 4134 ],
  118011. "I2": [ 5138 ],
  118012. "I3": [ 4135 ],
  118013. "O": [ 5134 ]
  118014. }
  118015. },
  118016. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  118017. "hide_name": 0,
  118018. "type": "SB_CARRY",
  118019. "parameters": {
  118020. },
  118021. "attributes": {
  118022. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  118023. },
  118024. "port_directions": {
  118025. "CI": "input",
  118026. "CO": "output",
  118027. "I0": "input",
  118028. "I1": "input"
  118029. },
  118030. "connections": {
  118031. "CI": [ "0" ],
  118032. "CO": [ 5137 ],
  118033. "I0": [ 4134 ],
  118034. "I1": [ 5132 ]
  118035. }
  118036. },
  118037. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_4": {
  118038. "hide_name": 0,
  118039. "type": "SB_LUT4",
  118040. "parameters": {
  118041. "LUT_INIT": "0000101010100000"
  118042. },
  118043. "attributes": {
  118044. "module_not_derived": "00000000000000000000000000000001",
  118045. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  118046. },
  118047. "port_directions": {
  118048. "I0": "input",
  118049. "I1": "input",
  118050. "I2": "input",
  118051. "I3": "input",
  118052. "O": "output"
  118053. },
  118054. "connections": {
  118055. "I0": [ 1018 ],
  118056. "I1": [ "0" ],
  118057. "I2": [ 5128 ],
  118058. "I3": [ 5139 ],
  118059. "O": [ 5127 ]
  118060. }
  118061. },
  118062. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_4_I2_SB_LUT4_O": {
  118063. "hide_name": 0,
  118064. "type": "SB_LUT4",
  118065. "parameters": {
  118066. "LUT_INIT": "0000000000001100"
  118067. },
  118068. "attributes": {
  118069. "module_not_derived": "00000000000000000000000000000001",
  118070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  118071. },
  118072. "port_directions": {
  118073. "I0": "input",
  118074. "I1": "input",
  118075. "I2": "input",
  118076. "I3": "input",
  118077. "O": "output"
  118078. },
  118079. "connections": {
  118080. "I0": [ "0" ],
  118081. "I1": [ 5122 ],
  118082. "I2": [ 5124 ],
  118083. "I3": [ 5126 ],
  118084. "O": [ 5140 ]
  118085. }
  118086. },
  118087. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  118088. "hide_name": 0,
  118089. "type": "SB_CARRY",
  118090. "parameters": {
  118091. },
  118092. "attributes": {
  118093. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  118094. },
  118095. "port_directions": {
  118096. "CI": "input",
  118097. "CO": "output",
  118098. "I0": "input",
  118099. "I1": "input"
  118100. },
  118101. "connections": {
  118102. "CI": [ 5137 ],
  118103. "CO": [ 5139 ],
  118104. "I0": [ "0" ],
  118105. "I1": [ 5130 ]
  118106. }
  118107. },
  118108. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_5": {
  118109. "hide_name": 0,
  118110. "type": "SB_LUT4",
  118111. "parameters": {
  118112. "LUT_INIT": "0000101010100000"
  118113. },
  118114. "attributes": {
  118115. "module_not_derived": "00000000000000000000000000000001",
  118116. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  118117. },
  118118. "port_directions": {
  118119. "I0": "input",
  118120. "I1": "input",
  118121. "I2": "input",
  118122. "I3": "input",
  118123. "O": "output"
  118124. },
  118125. "connections": {
  118126. "I0": [ 1018 ],
  118127. "I1": [ "0" ],
  118128. "I2": [ 5124 ],
  118129. "I3": [ 5136 ],
  118130. "O": [ 5123 ]
  118131. }
  118132. },
  118133. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  118134. "hide_name": 0,
  118135. "type": "SB_CARRY",
  118136. "parameters": {
  118137. },
  118138. "attributes": {
  118139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  118140. },
  118141. "port_directions": {
  118142. "CI": "input",
  118143. "CO": "output",
  118144. "I0": "input",
  118145. "I1": "input"
  118146. },
  118147. "connections": {
  118148. "CI": [ 5133 ],
  118149. "CO": [ 5136 ],
  118150. "I0": [ "0" ],
  118151. "I1": [ 5126 ]
  118152. }
  118153. },
  118154. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_I3_SB_CARRY_CO": {
  118155. "hide_name": 0,
  118156. "type": "SB_CARRY",
  118157. "parameters": {
  118158. },
  118159. "attributes": {
  118160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  118161. },
  118162. "port_directions": {
  118163. "CI": "input",
  118164. "CO": "output",
  118165. "I0": "input",
  118166. "I1": "input"
  118167. },
  118168. "connections": {
  118169. "CI": [ 5139 ],
  118170. "CO": [ 5133 ],
  118171. "I0": [ "0" ],
  118172. "I1": [ 5128 ]
  118173. }
  118174. },
  118175. "cpu_I.memory_DivPlugin_div_done_SB_DFFSR_Q": {
  118176. "hide_name": 0,
  118177. "type": "SB_DFFSR",
  118178. "parameters": {
  118179. },
  118180. "attributes": {
  118181. "module_not_derived": "00000000000000000000000000000001",
  118182. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  118183. },
  118184. "port_directions": {
  118185. "C": "input",
  118186. "D": "input",
  118187. "Q": "output",
  118188. "R": "input"
  118189. },
  118190. "connections": {
  118191. "C": [ 42 ],
  118192. "D": [ 5141 ],
  118193. "Q": [ 5142 ],
  118194. "R": [ 3995 ]
  118195. }
  118196. },
  118197. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I1": {
  118198. "hide_name": 0,
  118199. "type": "SB_LUT4",
  118200. "parameters": {
  118201. "LUT_INIT": "1100111111001100"
  118202. },
  118203. "attributes": {
  118204. "module_not_derived": "00000000000000000000000000000001",
  118205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  118206. },
  118207. "port_directions": {
  118208. "I0": "input",
  118209. "I1": "input",
  118210. "I2": "input",
  118211. "I3": "input",
  118212. "O": "output"
  118213. },
  118214. "connections": {
  118215. "I0": [ "0" ],
  118216. "I1": [ 5142 ],
  118217. "I2": [ 5132 ],
  118218. "I3": [ 5138 ],
  118219. "O": [ 5141 ]
  118220. }
  118221. },
  118222. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I1_I2_SB_LUT4_I1": {
  118223. "hide_name": 0,
  118224. "type": "SB_LUT4",
  118225. "parameters": {
  118226. "LUT_INIT": "0011000000000000"
  118227. },
  118228. "attributes": {
  118229. "module_not_derived": "00000000000000000000000000000001",
  118230. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  118231. },
  118232. "port_directions": {
  118233. "I0": "input",
  118234. "I1": "input",
  118235. "I2": "input",
  118236. "I3": "input",
  118237. "O": "output"
  118238. },
  118239. "connections": {
  118240. "I0": [ "0" ],
  118241. "I1": [ 5132 ],
  118242. "I2": [ 4134 ],
  118243. "I3": [ 5138 ],
  118244. "O": [ 5143 ]
  118245. }
  118246. },
  118247. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I1_I2_SB_LUT4_O": {
  118248. "hide_name": 0,
  118249. "type": "SB_LUT4",
  118250. "parameters": {
  118251. "LUT_INIT": "0000001100000000"
  118252. },
  118253. "attributes": {
  118254. "module_not_derived": "00000000000000000000000000000001",
  118255. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  118256. },
  118257. "port_directions": {
  118258. "I0": "input",
  118259. "I1": "input",
  118260. "I2": "input",
  118261. "I3": "input",
  118262. "O": "output"
  118263. },
  118264. "connections": {
  118265. "I0": [ "0" ],
  118266. "I1": [ 5128 ],
  118267. "I2": [ 5130 ],
  118268. "I3": [ 5140 ],
  118269. "O": [ 5138 ]
  118270. }
  118271. },
  118272. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I2": {
  118273. "hide_name": 0,
  118274. "type": "SB_LUT4",
  118275. "parameters": {
  118276. "LUT_INIT": "0000111100000000"
  118277. },
  118278. "attributes": {
  118279. "module_not_derived": "00000000000000000000000000000001",
  118280. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  118281. },
  118282. "port_directions": {
  118283. "I0": "input",
  118284. "I1": "input",
  118285. "I2": "input",
  118286. "I3": "input",
  118287. "O": "output"
  118288. },
  118289. "connections": {
  118290. "I0": [ "0" ],
  118291. "I1": [ "0" ],
  118292. "I2": [ 5142 ],
  118293. "I3": [ 3080 ],
  118294. "O": [ 4134 ]
  118295. }
  118296. },
  118297. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I2_O_SB_LUT4_I2": {
  118298. "hide_name": 0,
  118299. "type": "SB_LUT4",
  118300. "parameters": {
  118301. "LUT_INIT": "1111000011111111"
  118302. },
  118303. "attributes": {
  118304. "module_not_derived": "00000000000000000000000000000001",
  118305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  118306. },
  118307. "port_directions": {
  118308. "I0": "input",
  118309. "I1": "input",
  118310. "I2": "input",
  118311. "I3": "input",
  118312. "O": "output"
  118313. },
  118314. "connections": {
  118315. "I0": [ "0" ],
  118316. "I1": [ "0" ],
  118317. "I2": [ 4134 ],
  118318. "I3": [ 4135 ],
  118319. "O": [ 5089 ]
  118320. }
  118321. },
  118322. "cpu_I.memory_DivPlugin_div_needRevert_SB_DFFE_Q": {
  118323. "hide_name": 0,
  118324. "type": "SB_DFFE",
  118325. "parameters": {
  118326. },
  118327. "attributes": {
  118328. "module_not_derived": "00000000000000000000000000000001",
  118329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118330. },
  118331. "port_directions": {
  118332. "C": "input",
  118333. "D": "input",
  118334. "E": "input",
  118335. "Q": "output"
  118336. },
  118337. "connections": {
  118338. "C": [ 42 ],
  118339. "D": [ 5144 ],
  118340. "E": [ 3995 ],
  118341. "Q": [ 2604 ]
  118342. }
  118343. },
  118344. "cpu_I.memory_DivPlugin_div_needRevert_SB_DFFE_Q_D_SB_LUT4_O": {
  118345. "hide_name": 0,
  118346. "type": "SB_LUT4",
  118347. "parameters": {
  118348. "LUT_INIT": "0000000010110100"
  118349. },
  118350. "attributes": {
  118351. "module_not_derived": "00000000000000000000000000000001",
  118352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  118353. },
  118354. "port_directions": {
  118355. "I0": "input",
  118356. "I1": "input",
  118357. "I2": "input",
  118358. "I3": "input",
  118359. "O": "output"
  118360. },
  118361. "connections": {
  118362. "I0": [ 964 ],
  118363. "I1": [ 4150 ],
  118364. "I2": [ 3987 ],
  118365. "I3": [ 5145 ],
  118366. "O": [ 5144 ]
  118367. }
  118368. },
  118369. "cpu_I.memory_DivPlugin_div_needRevert_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  118370. "hide_name": 0,
  118371. "type": "SB_LUT4",
  118372. "parameters": {
  118373. "LUT_INIT": "1000000000000000"
  118374. },
  118375. "attributes": {
  118376. "module_not_derived": "00000000000000000000000000000001",
  118377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  118378. },
  118379. "port_directions": {
  118380. "I0": "input",
  118381. "I1": "input",
  118382. "I2": "input",
  118383. "I3": "input",
  118384. "O": "output"
  118385. },
  118386. "connections": {
  118387. "I0": [ 4232 ],
  118388. "I1": [ 4235 ],
  118389. "I2": [ 4242 ],
  118390. "I3": [ 4239 ],
  118391. "O": [ 5145 ]
  118392. }
  118393. },
  118394. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q": {
  118395. "hide_name": 0,
  118396. "type": "SB_DFFE",
  118397. "parameters": {
  118398. },
  118399. "attributes": {
  118400. "module_not_derived": "00000000000000000000000000000001",
  118401. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118402. },
  118403. "port_directions": {
  118404. "C": "input",
  118405. "D": "input",
  118406. "E": "input",
  118407. "Q": "output"
  118408. },
  118409. "connections": {
  118410. "C": [ 42 ],
  118411. "D": [ 2594 ],
  118412. "E": [ 5143 ],
  118413. "Q": [ 3170 ]
  118414. }
  118415. },
  118416. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_1": {
  118417. "hide_name": 0,
  118418. "type": "SB_DFFE",
  118419. "parameters": {
  118420. },
  118421. "attributes": {
  118422. "module_not_derived": "00000000000000000000000000000001",
  118423. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118424. },
  118425. "port_directions": {
  118426. "C": "input",
  118427. "D": "input",
  118428. "E": "input",
  118429. "Q": "output"
  118430. },
  118431. "connections": {
  118432. "C": [ 42 ],
  118433. "D": [ 2678 ],
  118434. "E": [ 5143 ],
  118435. "Q": [ 3187 ]
  118436. }
  118437. },
  118438. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_10": {
  118439. "hide_name": 0,
  118440. "type": "SB_DFFE",
  118441. "parameters": {
  118442. },
  118443. "attributes": {
  118444. "module_not_derived": "00000000000000000000000000000001",
  118445. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118446. },
  118447. "port_directions": {
  118448. "C": "input",
  118449. "D": "input",
  118450. "E": "input",
  118451. "Q": "output"
  118452. },
  118453. "connections": {
  118454. "C": [ 42 ],
  118455. "D": [ 2619 ],
  118456. "E": [ 5143 ],
  118457. "Q": [ 3220 ]
  118458. }
  118459. },
  118460. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_11": {
  118461. "hide_name": 0,
  118462. "type": "SB_DFFE",
  118463. "parameters": {
  118464. },
  118465. "attributes": {
  118466. "module_not_derived": "00000000000000000000000000000001",
  118467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118468. },
  118469. "port_directions": {
  118470. "C": "input",
  118471. "D": "input",
  118472. "E": "input",
  118473. "Q": "output"
  118474. },
  118475. "connections": {
  118476. "C": [ 42 ],
  118477. "D": [ 2614 ],
  118478. "E": [ 5143 ],
  118479. "Q": [ 3123 ]
  118480. }
  118481. },
  118482. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_12": {
  118483. "hide_name": 0,
  118484. "type": "SB_DFFE",
  118485. "parameters": {
  118486. },
  118487. "attributes": {
  118488. "module_not_derived": "00000000000000000000000000000001",
  118489. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118490. },
  118491. "port_directions": {
  118492. "C": "input",
  118493. "D": "input",
  118494. "E": "input",
  118495. "Q": "output"
  118496. },
  118497. "connections": {
  118498. "C": [ 42 ],
  118499. "D": [ 2609 ],
  118500. "E": [ 5143 ],
  118501. "Q": [ 3116 ]
  118502. }
  118503. },
  118504. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_13": {
  118505. "hide_name": 0,
  118506. "type": "SB_DFFE",
  118507. "parameters": {
  118508. },
  118509. "attributes": {
  118510. "module_not_derived": "00000000000000000000000000000001",
  118511. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118512. },
  118513. "port_directions": {
  118514. "C": "input",
  118515. "D": "input",
  118516. "E": "input",
  118517. "Q": "output"
  118518. },
  118519. "connections": {
  118520. "C": [ 42 ],
  118521. "D": [ 2600 ],
  118522. "E": [ 5143 ],
  118523. "Q": [ 3109 ]
  118524. }
  118525. },
  118526. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_14": {
  118527. "hide_name": 0,
  118528. "type": "SB_DFFE",
  118529. "parameters": {
  118530. },
  118531. "attributes": {
  118532. "module_not_derived": "00000000000000000000000000000001",
  118533. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118534. },
  118535. "port_directions": {
  118536. "C": "input",
  118537. "D": "input",
  118538. "E": "input",
  118539. "Q": "output"
  118540. },
  118541. "connections": {
  118542. "C": [ 42 ],
  118543. "D": [ 2748 ],
  118544. "E": [ 5143 ],
  118545. "Q": [ 3102 ]
  118546. }
  118547. },
  118548. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_15": {
  118549. "hide_name": 0,
  118550. "type": "SB_DFFE",
  118551. "parameters": {
  118552. },
  118553. "attributes": {
  118554. "module_not_derived": "00000000000000000000000000000001",
  118555. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118556. },
  118557. "port_directions": {
  118558. "C": "input",
  118559. "D": "input",
  118560. "E": "input",
  118561. "Q": "output"
  118562. },
  118563. "connections": {
  118564. "C": [ 42 ],
  118565. "D": [ 2745 ],
  118566. "E": [ 5143 ],
  118567. "Q": [ 3097 ]
  118568. }
  118569. },
  118570. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_16": {
  118571. "hide_name": 0,
  118572. "type": "SB_DFFE",
  118573. "parameters": {
  118574. },
  118575. "attributes": {
  118576. "module_not_derived": "00000000000000000000000000000001",
  118577. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118578. },
  118579. "port_directions": {
  118580. "C": "input",
  118581. "D": "input",
  118582. "E": "input",
  118583. "Q": "output"
  118584. },
  118585. "connections": {
  118586. "C": [ 42 ],
  118587. "D": [ 2740 ],
  118588. "E": [ 5143 ],
  118589. "Q": [ 3086 ]
  118590. }
  118591. },
  118592. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_17": {
  118593. "hide_name": 0,
  118594. "type": "SB_DFFE",
  118595. "parameters": {
  118596. },
  118597. "attributes": {
  118598. "module_not_derived": "00000000000000000000000000000001",
  118599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118600. },
  118601. "port_directions": {
  118602. "C": "input",
  118603. "D": "input",
  118604. "E": "input",
  118605. "Q": "output"
  118606. },
  118607. "connections": {
  118608. "C": [ 42 ],
  118609. "D": [ 2735 ],
  118610. "E": [ 5143 ],
  118611. "Q": [ 3269 ]
  118612. }
  118613. },
  118614. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_18": {
  118615. "hide_name": 0,
  118616. "type": "SB_DFFE",
  118617. "parameters": {
  118618. },
  118619. "attributes": {
  118620. "module_not_derived": "00000000000000000000000000000001",
  118621. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118622. },
  118623. "port_directions": {
  118624. "C": "input",
  118625. "D": "input",
  118626. "E": "input",
  118627. "Q": "output"
  118628. },
  118629. "connections": {
  118630. "C": [ 42 ],
  118631. "D": [ 2730 ],
  118632. "E": [ 5143 ],
  118633. "Q": [ 3264 ]
  118634. }
  118635. },
  118636. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_19": {
  118637. "hide_name": 0,
  118638. "type": "SB_DFFE",
  118639. "parameters": {
  118640. },
  118641. "attributes": {
  118642. "module_not_derived": "00000000000000000000000000000001",
  118643. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118644. },
  118645. "port_directions": {
  118646. "C": "input",
  118647. "D": "input",
  118648. "E": "input",
  118649. "Q": "output"
  118650. },
  118651. "connections": {
  118652. "C": [ 42 ],
  118653. "D": [ 2725 ],
  118654. "E": [ 5143 ],
  118655. "Q": [ 3259 ]
  118656. }
  118657. },
  118658. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_2": {
  118659. "hide_name": 0,
  118660. "type": "SB_DFFE",
  118661. "parameters": {
  118662. },
  118663. "attributes": {
  118664. "module_not_derived": "00000000000000000000000000000001",
  118665. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118666. },
  118667. "port_directions": {
  118668. "C": "input",
  118669. "D": "input",
  118670. "E": "input",
  118671. "Q": "output"
  118672. },
  118673. "connections": {
  118674. "C": [ 42 ],
  118675. "D": [ 2673 ],
  118676. "E": [ 5143 ],
  118677. "Q": [ 3201 ]
  118678. }
  118679. },
  118680. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_20": {
  118681. "hide_name": 0,
  118682. "type": "SB_DFFE",
  118683. "parameters": {
  118684. },
  118685. "attributes": {
  118686. "module_not_derived": "00000000000000000000000000000001",
  118687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118688. },
  118689. "port_directions": {
  118690. "C": "input",
  118691. "D": "input",
  118692. "E": "input",
  118693. "Q": "output"
  118694. },
  118695. "connections": {
  118696. "C": [ 42 ],
  118697. "D": [ 2715 ],
  118698. "E": [ 5143 ],
  118699. "Q": [ 3254 ]
  118700. }
  118701. },
  118702. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_21": {
  118703. "hide_name": 0,
  118704. "type": "SB_DFFE",
  118705. "parameters": {
  118706. },
  118707. "attributes": {
  118708. "module_not_derived": "00000000000000000000000000000001",
  118709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118710. },
  118711. "port_directions": {
  118712. "C": "input",
  118713. "D": "input",
  118714. "E": "input",
  118715. "Q": "output"
  118716. },
  118717. "connections": {
  118718. "C": [ 42 ],
  118719. "D": [ 2658 ],
  118720. "E": [ 5143 ],
  118721. "Q": [ 3237 ]
  118722. }
  118723. },
  118724. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_22": {
  118725. "hide_name": 0,
  118726. "type": "SB_DFFE",
  118727. "parameters": {
  118728. },
  118729. "attributes": {
  118730. "module_not_derived": "00000000000000000000000000000001",
  118731. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118732. },
  118733. "port_directions": {
  118734. "C": "input",
  118735. "D": "input",
  118736. "E": "input",
  118737. "Q": "output"
  118738. },
  118739. "connections": {
  118740. "C": [ 42 ],
  118741. "D": [ 2597 ],
  118742. "E": [ 5143 ],
  118743. "Q": [ 3249 ]
  118744. }
  118745. },
  118746. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_23": {
  118747. "hide_name": 0,
  118748. "type": "SB_DFFE",
  118749. "parameters": {
  118750. },
  118751. "attributes": {
  118752. "module_not_derived": "00000000000000000000000000000001",
  118753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118754. },
  118755. "port_directions": {
  118756. "C": "input",
  118757. "D": "input",
  118758. "E": "input",
  118759. "Q": "output"
  118760. },
  118761. "connections": {
  118762. "C": [ 42 ],
  118763. "D": [ 2716 ],
  118764. "E": [ 5143 ],
  118765. "Q": [ 3182 ]
  118766. }
  118767. },
  118768. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_24": {
  118769. "hide_name": 0,
  118770. "type": "SB_DFFE",
  118771. "parameters": {
  118772. },
  118773. "attributes": {
  118774. "module_not_derived": "00000000000000000000000000000001",
  118775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118776. },
  118777. "port_directions": {
  118778. "C": "input",
  118779. "D": "input",
  118780. "E": "input",
  118781. "Q": "output"
  118782. },
  118783. "connections": {
  118784. "C": [ 42 ],
  118785. "D": [ 2708 ],
  118786. "E": [ 5143 ],
  118787. "Q": [ 3244 ]
  118788. }
  118789. },
  118790. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_25": {
  118791. "hide_name": 0,
  118792. "type": "SB_DFFE",
  118793. "parameters": {
  118794. },
  118795. "attributes": {
  118796. "module_not_derived": "00000000000000000000000000000001",
  118797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118798. },
  118799. "port_directions": {
  118800. "C": "input",
  118801. "D": "input",
  118802. "E": "input",
  118803. "Q": "output"
  118804. },
  118805. "connections": {
  118806. "C": [ 42 ],
  118807. "D": [ 2703 ],
  118808. "E": [ 5143 ],
  118809. "Q": [ 3229 ]
  118810. }
  118811. },
  118812. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_26": {
  118813. "hide_name": 0,
  118814. "type": "SB_DFFE",
  118815. "parameters": {
  118816. },
  118817. "attributes": {
  118818. "module_not_derived": "00000000000000000000000000000001",
  118819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118820. },
  118821. "port_directions": {
  118822. "C": "input",
  118823. "D": "input",
  118824. "E": "input",
  118825. "Q": "output"
  118826. },
  118827. "connections": {
  118828. "C": [ 42 ],
  118829. "D": [ 2698 ],
  118830. "E": [ 5143 ],
  118831. "Q": [ 3162 ]
  118832. }
  118833. },
  118834. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_27": {
  118835. "hide_name": 0,
  118836. "type": "SB_DFFE",
  118837. "parameters": {
  118838. },
  118839. "attributes": {
  118840. "module_not_derived": "00000000000000000000000000000001",
  118841. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118842. },
  118843. "port_directions": {
  118844. "C": "input",
  118845. "D": "input",
  118846. "E": "input",
  118847. "Q": "output"
  118848. },
  118849. "connections": {
  118850. "C": [ 42 ],
  118851. "D": [ 2693 ],
  118852. "E": [ 5143 ],
  118853. "Q": [ 3083 ]
  118854. }
  118855. },
  118856. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_28": {
  118857. "hide_name": 0,
  118858. "type": "SB_DFFE",
  118859. "parameters": {
  118860. },
  118861. "attributes": {
  118862. "module_not_derived": "00000000000000000000000000000001",
  118863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118864. },
  118865. "port_directions": {
  118866. "C": "input",
  118867. "D": "input",
  118868. "E": "input",
  118869. "Q": "output"
  118870. },
  118871. "connections": {
  118872. "C": [ 42 ],
  118873. "D": [ 2688 ],
  118874. "E": [ 5143 ],
  118875. "Q": [ 3079 ]
  118876. }
  118877. },
  118878. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_29": {
  118879. "hide_name": 0,
  118880. "type": "SB_DFFE",
  118881. "parameters": {
  118882. },
  118883. "attributes": {
  118884. "module_not_derived": "00000000000000000000000000000001",
  118885. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118886. },
  118887. "port_directions": {
  118888. "C": "input",
  118889. "D": "input",
  118890. "E": "input",
  118891. "Q": "output"
  118892. },
  118893. "connections": {
  118894. "C": [ 42 ],
  118895. "D": [ 2683 ],
  118896. "E": [ 5143 ],
  118897. "Q": [ 3194 ]
  118898. }
  118899. },
  118900. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_3": {
  118901. "hide_name": 0,
  118902. "type": "SB_DFFE",
  118903. "parameters": {
  118904. },
  118905. "attributes": {
  118906. "module_not_derived": "00000000000000000000000000000001",
  118907. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118908. },
  118909. "port_directions": {
  118910. "C": "input",
  118911. "D": "input",
  118912. "E": "input",
  118913. "Q": "output"
  118914. },
  118915. "connections": {
  118916. "C": [ 42 ],
  118917. "D": [ 2661 ],
  118918. "E": [ 5143 ],
  118919. "Q": [ 3206 ]
  118920. }
  118921. },
  118922. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_30": {
  118923. "hide_name": 0,
  118924. "type": "SB_DFFE",
  118925. "parameters": {
  118926. },
  118927. "attributes": {
  118928. "module_not_derived": "00000000000000000000000000000001",
  118929. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118930. },
  118931. "port_directions": {
  118932. "C": "input",
  118933. "D": "input",
  118934. "E": "input",
  118935. "Q": "output"
  118936. },
  118937. "connections": {
  118938. "C": [ 42 ],
  118939. "D": [ 2666 ],
  118940. "E": [ 5143 ],
  118941. "Q": [ 3232 ]
  118942. }
  118943. },
  118944. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_31": {
  118945. "hide_name": 0,
  118946. "type": "SB_DFFE",
  118947. "parameters": {
  118948. },
  118949. "attributes": {
  118950. "module_not_derived": "00000000000000000000000000000001",
  118951. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118952. },
  118953. "port_directions": {
  118954. "C": "input",
  118955. "D": "input",
  118956. "E": "input",
  118957. "Q": "output"
  118958. },
  118959. "connections": {
  118960. "C": [ 42 ],
  118961. "D": [ 2670 ],
  118962. "E": [ 5143 ],
  118963. "Q": [ 3177 ]
  118964. }
  118965. },
  118966. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_4": {
  118967. "hide_name": 0,
  118968. "type": "SB_DFFE",
  118969. "parameters": {
  118970. },
  118971. "attributes": {
  118972. "module_not_derived": "00000000000000000000000000000001",
  118973. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118974. },
  118975. "port_directions": {
  118976. "C": "input",
  118977. "D": "input",
  118978. "E": "input",
  118979. "Q": "output"
  118980. },
  118981. "connections": {
  118982. "C": [ 42 ],
  118983. "D": [ 2649 ],
  118984. "E": [ 5143 ],
  118985. "Q": [ 3165 ]
  118986. }
  118987. },
  118988. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_5": {
  118989. "hide_name": 0,
  118990. "type": "SB_DFFE",
  118991. "parameters": {
  118992. },
  118993. "attributes": {
  118994. "module_not_derived": "00000000000000000000000000000001",
  118995. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  118996. },
  118997. "port_directions": {
  118998. "C": "input",
  118999. "D": "input",
  119000. "E": "input",
  119001. "Q": "output"
  119002. },
  119003. "connections": {
  119004. "C": [ 42 ],
  119005. "D": [ 2644 ],
  119006. "E": [ 5143 ],
  119007. "Q": [ 3151 ]
  119008. }
  119009. },
  119010. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_6": {
  119011. "hide_name": 0,
  119012. "type": "SB_DFFE",
  119013. "parameters": {
  119014. },
  119015. "attributes": {
  119016. "module_not_derived": "00000000000000000000000000000001",
  119017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  119018. },
  119019. "port_directions": {
  119020. "C": "input",
  119021. "D": "input",
  119022. "E": "input",
  119023. "Q": "output"
  119024. },
  119025. "connections": {
  119026. "C": [ 42 ],
  119027. "D": [ 2639 ],
  119028. "E": [ 5143 ],
  119029. "Q": [ 3144 ]
  119030. }
  119031. },
  119032. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_7": {
  119033. "hide_name": 0,
  119034. "type": "SB_DFFE",
  119035. "parameters": {
  119036. },
  119037. "attributes": {
  119038. "module_not_derived": "00000000000000000000000000000001",
  119039. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  119040. },
  119041. "port_directions": {
  119042. "C": "input",
  119043. "D": "input",
  119044. "E": "input",
  119045. "Q": "output"
  119046. },
  119047. "connections": {
  119048. "C": [ 42 ],
  119049. "D": [ 2634 ],
  119050. "E": [ 5143 ],
  119051. "Q": [ 3137 ]
  119052. }
  119053. },
  119054. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_8": {
  119055. "hide_name": 0,
  119056. "type": "SB_DFFE",
  119057. "parameters": {
  119058. },
  119059. "attributes": {
  119060. "module_not_derived": "00000000000000000000000000000001",
  119061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  119062. },
  119063. "port_directions": {
  119064. "C": "input",
  119065. "D": "input",
  119066. "E": "input",
  119067. "Q": "output"
  119068. },
  119069. "connections": {
  119070. "C": [ 42 ],
  119071. "D": [ 2629 ],
  119072. "E": [ 5143 ],
  119073. "Q": [ 3213 ]
  119074. }
  119075. },
  119076. "cpu_I.memory_DivPlugin_div_result_SB_DFFE_Q_9": {
  119077. "hide_name": 0,
  119078. "type": "SB_DFFE",
  119079. "parameters": {
  119080. },
  119081. "attributes": {
  119082. "module_not_derived": "00000000000000000000000000000001",
  119083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  119084. },
  119085. "port_directions": {
  119086. "C": "input",
  119087. "D": "input",
  119088. "E": "input",
  119089. "Q": "output"
  119090. },
  119091. "connections": {
  119092. "C": [ 42 ],
  119093. "D": [ 2624 ],
  119094. "E": [ 5143 ],
  119095. "Q": [ 3130 ]
  119096. }
  119097. },
  119098. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O": {
  119099. "hide_name": 0,
  119100. "type": "SB_LUT4",
  119101. "parameters": {
  119102. "LUT_INIT": "1100100110011100"
  119103. },
  119104. "attributes": {
  119105. "module_not_derived": "00000000000000000000000000000001",
  119106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119107. },
  119108. "port_directions": {
  119109. "I0": "input",
  119110. "I1": "input",
  119111. "I2": "input",
  119112. "I3": "input",
  119113. "O": "output"
  119114. },
  119115. "connections": {
  119116. "I0": [ 4104 ],
  119117. "I1": [ 2717 ],
  119118. "I2": [ 5146 ],
  119119. "I3": [ 5147 ],
  119120. "O": [ 5104 ]
  119121. }
  119122. },
  119123. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_1": {
  119124. "hide_name": 0,
  119125. "type": "SB_LUT4",
  119126. "parameters": {
  119127. "LUT_INIT": "1100100110011100"
  119128. },
  119129. "attributes": {
  119130. "module_not_derived": "00000000000000000000000000000001",
  119131. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119132. },
  119133. "port_directions": {
  119134. "I0": "input",
  119135. "I1": "input",
  119136. "I2": "input",
  119137. "I3": "input",
  119138. "O": "output"
  119139. },
  119140. "connections": {
  119141. "I0": [ 4104 ],
  119142. "I1": [ 2652 ],
  119143. "I2": [ 5148 ],
  119144. "I3": [ 5149 ],
  119145. "O": [ 5103 ]
  119146. }
  119147. },
  119148. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_10": {
  119149. "hide_name": 0,
  119150. "type": "SB_LUT4",
  119151. "parameters": {
  119152. "LUT_INIT": "1100100110011100"
  119153. },
  119154. "attributes": {
  119155. "module_not_derived": "00000000000000000000000000000001",
  119156. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119157. },
  119158. "port_directions": {
  119159. "I0": "input",
  119160. "I1": "input",
  119161. "I2": "input",
  119162. "I3": "input",
  119163. "O": "output"
  119164. },
  119165. "connections": {
  119166. "I0": [ 4104 ],
  119167. "I1": [ 2752 ],
  119168. "I2": [ 5150 ],
  119169. "I3": [ "1" ],
  119170. "O": [ 5114 ]
  119171. }
  119172. },
  119173. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_10_I2_SB_LUT4_O": {
  119174. "hide_name": 0,
  119175. "type": "SB_LUT4",
  119176. "parameters": {
  119177. "LUT_INIT": "0000000011111111"
  119178. },
  119179. "attributes": {
  119180. "module_not_derived": "00000000000000000000000000000001",
  119181. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119182. },
  119183. "port_directions": {
  119184. "I0": "input",
  119185. "I1": "input",
  119186. "I2": "input",
  119187. "I3": "input",
  119188. "O": "output"
  119189. },
  119190. "connections": {
  119191. "I0": [ "0" ],
  119192. "I1": [ "0" ],
  119193. "I2": [ "0" ],
  119194. "I3": [ 5151 ],
  119195. "O": [ 5150 ]
  119196. }
  119197. },
  119198. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_11": {
  119199. "hide_name": 0,
  119200. "type": "SB_LUT4",
  119201. "parameters": {
  119202. "LUT_INIT": "1100100110011100"
  119203. },
  119204. "attributes": {
  119205. "module_not_derived": "00000000000000000000000000000001",
  119206. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119207. },
  119208. "port_directions": {
  119209. "I0": "input",
  119210. "I1": "input",
  119211. "I2": "input",
  119212. "I3": "input",
  119213. "O": "output"
  119214. },
  119215. "connections": {
  119216. "I0": [ 4104 ],
  119217. "I1": [ 2601 ],
  119218. "I2": [ 5152 ],
  119219. "I3": [ 5153 ],
  119220. "O": [ 5093 ]
  119221. }
  119222. },
  119223. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_11_I2_SB_LUT4_O": {
  119224. "hide_name": 0,
  119225. "type": "SB_LUT4",
  119226. "parameters": {
  119227. "LUT_INIT": "0000000011111111"
  119228. },
  119229. "attributes": {
  119230. "module_not_derived": "00000000000000000000000000000001",
  119231. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119232. },
  119233. "port_directions": {
  119234. "I0": "input",
  119235. "I1": "input",
  119236. "I2": "input",
  119237. "I3": "input",
  119238. "O": "output"
  119239. },
  119240. "connections": {
  119241. "I0": [ "0" ],
  119242. "I1": [ "0" ],
  119243. "I2": [ "0" ],
  119244. "I3": [ 5154 ],
  119245. "O": [ 5152 ]
  119246. }
  119247. },
  119248. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  119249. "hide_name": 0,
  119250. "type": "SB_CARRY",
  119251. "parameters": {
  119252. },
  119253. "attributes": {
  119254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119255. },
  119256. "port_directions": {
  119257. "CI": "input",
  119258. "CO": "output",
  119259. "I0": "input",
  119260. "I1": "input"
  119261. },
  119262. "connections": {
  119263. "CI": [ 5155 ],
  119264. "CO": [ 5153 ],
  119265. "I0": [ 2749 ],
  119266. "I1": [ 5156 ]
  119267. }
  119268. },
  119269. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_12": {
  119270. "hide_name": 0,
  119271. "type": "SB_LUT4",
  119272. "parameters": {
  119273. "LUT_INIT": "1100100110011100"
  119274. },
  119275. "attributes": {
  119276. "module_not_derived": "00000000000000000000000000000001",
  119277. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119278. },
  119279. "port_directions": {
  119280. "I0": "input",
  119281. "I1": "input",
  119282. "I2": "input",
  119283. "I3": "input",
  119284. "O": "output"
  119285. },
  119286. "connections": {
  119287. "I0": [ 4104 ],
  119288. "I1": [ 2610 ],
  119289. "I2": [ 5157 ],
  119290. "I3": [ 5158 ],
  119291. "O": [ 5092 ]
  119292. }
  119293. },
  119294. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_12_I2_SB_LUT4_O": {
  119295. "hide_name": 0,
  119296. "type": "SB_LUT4",
  119297. "parameters": {
  119298. "LUT_INIT": "0000000011111111"
  119299. },
  119300. "attributes": {
  119301. "module_not_derived": "00000000000000000000000000000001",
  119302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119303. },
  119304. "port_directions": {
  119305. "I0": "input",
  119306. "I1": "input",
  119307. "I2": "input",
  119308. "I3": "input",
  119309. "O": "output"
  119310. },
  119311. "connections": {
  119312. "I0": [ "0" ],
  119313. "I1": [ "0" ],
  119314. "I2": [ "0" ],
  119315. "I3": [ 5159 ],
  119316. "O": [ 5157 ]
  119317. }
  119318. },
  119319. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  119320. "hide_name": 0,
  119321. "type": "SB_CARRY",
  119322. "parameters": {
  119323. },
  119324. "attributes": {
  119325. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119326. },
  119327. "port_directions": {
  119328. "CI": "input",
  119329. "CO": "output",
  119330. "I0": "input",
  119331. "I1": "input"
  119332. },
  119333. "connections": {
  119334. "CI": [ 5153 ],
  119335. "CO": [ 5158 ],
  119336. "I0": [ 2601 ],
  119337. "I1": [ 5152 ]
  119338. }
  119339. },
  119340. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_13": {
  119341. "hide_name": 0,
  119342. "type": "SB_LUT4",
  119343. "parameters": {
  119344. "LUT_INIT": "1100100110011100"
  119345. },
  119346. "attributes": {
  119347. "module_not_derived": "00000000000000000000000000000001",
  119348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119349. },
  119350. "port_directions": {
  119351. "I0": "input",
  119352. "I1": "input",
  119353. "I2": "input",
  119354. "I3": "input",
  119355. "O": "output"
  119356. },
  119357. "connections": {
  119358. "I0": [ 4104 ],
  119359. "I1": [ 2615 ],
  119360. "I2": [ 5160 ],
  119361. "I3": [ 5161 ],
  119362. "O": [ 5091 ]
  119363. }
  119364. },
  119365. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_13_I2_SB_LUT4_O": {
  119366. "hide_name": 0,
  119367. "type": "SB_LUT4",
  119368. "parameters": {
  119369. "LUT_INIT": "0000000011111111"
  119370. },
  119371. "attributes": {
  119372. "module_not_derived": "00000000000000000000000000000001",
  119373. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119374. },
  119375. "port_directions": {
  119376. "I0": "input",
  119377. "I1": "input",
  119378. "I2": "input",
  119379. "I3": "input",
  119380. "O": "output"
  119381. },
  119382. "connections": {
  119383. "I0": [ "0" ],
  119384. "I1": [ "0" ],
  119385. "I2": [ "0" ],
  119386. "I3": [ 5162 ],
  119387. "O": [ 5160 ]
  119388. }
  119389. },
  119390. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  119391. "hide_name": 0,
  119392. "type": "SB_CARRY",
  119393. "parameters": {
  119394. },
  119395. "attributes": {
  119396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119397. },
  119398. "port_directions": {
  119399. "CI": "input",
  119400. "CO": "output",
  119401. "I0": "input",
  119402. "I1": "input"
  119403. },
  119404. "connections": {
  119405. "CI": [ 5158 ],
  119406. "CO": [ 5161 ],
  119407. "I0": [ 2610 ],
  119408. "I1": [ 5157 ]
  119409. }
  119410. },
  119411. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_14": {
  119412. "hide_name": 0,
  119413. "type": "SB_LUT4",
  119414. "parameters": {
  119415. "LUT_INIT": "1100100110011100"
  119416. },
  119417. "attributes": {
  119418. "module_not_derived": "00000000000000000000000000000001",
  119419. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119420. },
  119421. "port_directions": {
  119422. "I0": "input",
  119423. "I1": "input",
  119424. "I2": "input",
  119425. "I3": "input",
  119426. "O": "output"
  119427. },
  119428. "connections": {
  119429. "I0": [ 4104 ],
  119430. "I1": [ 2620 ],
  119431. "I2": [ 5163 ],
  119432. "I3": [ 5164 ],
  119433. "O": [ 5120 ]
  119434. }
  119435. },
  119436. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  119437. "hide_name": 0,
  119438. "type": "SB_CARRY",
  119439. "parameters": {
  119440. },
  119441. "attributes": {
  119442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119443. },
  119444. "port_directions": {
  119445. "CI": "input",
  119446. "CO": "output",
  119447. "I0": "input",
  119448. "I1": "input"
  119449. },
  119450. "connections": {
  119451. "CI": [ 5161 ],
  119452. "CO": [ 5164 ],
  119453. "I0": [ 2615 ],
  119454. "I1": [ 5160 ]
  119455. }
  119456. },
  119457. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_15": {
  119458. "hide_name": 0,
  119459. "type": "SB_LUT4",
  119460. "parameters": {
  119461. "LUT_INIT": "1100100110011100"
  119462. },
  119463. "attributes": {
  119464. "module_not_derived": "00000000000000000000000000000001",
  119465. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119466. },
  119467. "port_directions": {
  119468. "I0": "input",
  119469. "I1": "input",
  119470. "I2": "input",
  119471. "I3": "input",
  119472. "O": "output"
  119473. },
  119474. "connections": {
  119475. "I0": [ 4104 ],
  119476. "I1": [ 2625 ],
  119477. "I2": [ 5165 ],
  119478. "I3": [ 5166 ],
  119479. "O": [ 5119 ]
  119480. }
  119481. },
  119482. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_15_I2_SB_LUT4_O": {
  119483. "hide_name": 0,
  119484. "type": "SB_LUT4",
  119485. "parameters": {
  119486. "LUT_INIT": "0000000011111111"
  119487. },
  119488. "attributes": {
  119489. "module_not_derived": "00000000000000000000000000000001",
  119490. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119491. },
  119492. "port_directions": {
  119493. "I0": "input",
  119494. "I1": "input",
  119495. "I2": "input",
  119496. "I3": "input",
  119497. "O": "output"
  119498. },
  119499. "connections": {
  119500. "I0": [ "0" ],
  119501. "I1": [ "0" ],
  119502. "I2": [ "0" ],
  119503. "I3": [ 5167 ],
  119504. "O": [ 5165 ]
  119505. }
  119506. },
  119507. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  119508. "hide_name": 0,
  119509. "type": "SB_CARRY",
  119510. "parameters": {
  119511. },
  119512. "attributes": {
  119513. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119514. },
  119515. "port_directions": {
  119516. "CI": "input",
  119517. "CO": "output",
  119518. "I0": "input",
  119519. "I1": "input"
  119520. },
  119521. "connections": {
  119522. "CI": [ 5164 ],
  119523. "CO": [ 5166 ],
  119524. "I0": [ 2620 ],
  119525. "I1": [ 5163 ]
  119526. }
  119527. },
  119528. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_16": {
  119529. "hide_name": 0,
  119530. "type": "SB_LUT4",
  119531. "parameters": {
  119532. "LUT_INIT": "1100100110011100"
  119533. },
  119534. "attributes": {
  119535. "module_not_derived": "00000000000000000000000000000001",
  119536. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119537. },
  119538. "port_directions": {
  119539. "I0": "input",
  119540. "I1": "input",
  119541. "I2": "input",
  119542. "I3": "input",
  119543. "O": "output"
  119544. },
  119545. "connections": {
  119546. "I0": [ 4104 ],
  119547. "I1": [ 2630 ],
  119548. "I2": [ 5168 ],
  119549. "I3": [ 5169 ],
  119550. "O": [ 5118 ]
  119551. }
  119552. },
  119553. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_16_I2_SB_LUT4_O": {
  119554. "hide_name": 0,
  119555. "type": "SB_LUT4",
  119556. "parameters": {
  119557. "LUT_INIT": "0000000011111111"
  119558. },
  119559. "attributes": {
  119560. "module_not_derived": "00000000000000000000000000000001",
  119561. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119562. },
  119563. "port_directions": {
  119564. "I0": "input",
  119565. "I1": "input",
  119566. "I2": "input",
  119567. "I3": "input",
  119568. "O": "output"
  119569. },
  119570. "connections": {
  119571. "I0": [ "0" ],
  119572. "I1": [ "0" ],
  119573. "I2": [ "0" ],
  119574. "I3": [ 5170 ],
  119575. "O": [ 5168 ]
  119576. }
  119577. },
  119578. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  119579. "hide_name": 0,
  119580. "type": "SB_CARRY",
  119581. "parameters": {
  119582. },
  119583. "attributes": {
  119584. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119585. },
  119586. "port_directions": {
  119587. "CI": "input",
  119588. "CO": "output",
  119589. "I0": "input",
  119590. "I1": "input"
  119591. },
  119592. "connections": {
  119593. "CI": [ 5166 ],
  119594. "CO": [ 5169 ],
  119595. "I0": [ 2625 ],
  119596. "I1": [ 5165 ]
  119597. }
  119598. },
  119599. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_17": {
  119600. "hide_name": 0,
  119601. "type": "SB_LUT4",
  119602. "parameters": {
  119603. "LUT_INIT": "1100100110011100"
  119604. },
  119605. "attributes": {
  119606. "module_not_derived": "00000000000000000000000000000001",
  119607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119608. },
  119609. "port_directions": {
  119610. "I0": "input",
  119611. "I1": "input",
  119612. "I2": "input",
  119613. "I3": "input",
  119614. "O": "output"
  119615. },
  119616. "connections": {
  119617. "I0": [ 4104 ],
  119618. "I1": [ 2635 ],
  119619. "I2": [ 5171 ],
  119620. "I3": [ 5172 ],
  119621. "O": [ 5117 ]
  119622. }
  119623. },
  119624. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_17_I2_SB_LUT4_O": {
  119625. "hide_name": 0,
  119626. "type": "SB_LUT4",
  119627. "parameters": {
  119628. "LUT_INIT": "0000000011111111"
  119629. },
  119630. "attributes": {
  119631. "module_not_derived": "00000000000000000000000000000001",
  119632. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119633. },
  119634. "port_directions": {
  119635. "I0": "input",
  119636. "I1": "input",
  119637. "I2": "input",
  119638. "I3": "input",
  119639. "O": "output"
  119640. },
  119641. "connections": {
  119642. "I0": [ "0" ],
  119643. "I1": [ "0" ],
  119644. "I2": [ "0" ],
  119645. "I3": [ 5173 ],
  119646. "O": [ 5171 ]
  119647. }
  119648. },
  119649. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_17_I3_SB_CARRY_CO": {
  119650. "hide_name": 0,
  119651. "type": "SB_CARRY",
  119652. "parameters": {
  119653. },
  119654. "attributes": {
  119655. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119656. },
  119657. "port_directions": {
  119658. "CI": "input",
  119659. "CO": "output",
  119660. "I0": "input",
  119661. "I1": "input"
  119662. },
  119663. "connections": {
  119664. "CI": [ 5169 ],
  119665. "CO": [ 5172 ],
  119666. "I0": [ 2630 ],
  119667. "I1": [ 5168 ]
  119668. }
  119669. },
  119670. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_18": {
  119671. "hide_name": 0,
  119672. "type": "SB_LUT4",
  119673. "parameters": {
  119674. "LUT_INIT": "1100100110011100"
  119675. },
  119676. "attributes": {
  119677. "module_not_derived": "00000000000000000000000000000001",
  119678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119679. },
  119680. "port_directions": {
  119681. "I0": "input",
  119682. "I1": "input",
  119683. "I2": "input",
  119684. "I3": "input",
  119685. "O": "output"
  119686. },
  119687. "connections": {
  119688. "I0": [ 4104 ],
  119689. "I1": [ 2640 ],
  119690. "I2": [ 5174 ],
  119691. "I3": [ 5175 ],
  119692. "O": [ 5116 ]
  119693. }
  119694. },
  119695. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_18_I2_SB_LUT4_O": {
  119696. "hide_name": 0,
  119697. "type": "SB_LUT4",
  119698. "parameters": {
  119699. "LUT_INIT": "0000000011111111"
  119700. },
  119701. "attributes": {
  119702. "module_not_derived": "00000000000000000000000000000001",
  119703. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119704. },
  119705. "port_directions": {
  119706. "I0": "input",
  119707. "I1": "input",
  119708. "I2": "input",
  119709. "I3": "input",
  119710. "O": "output"
  119711. },
  119712. "connections": {
  119713. "I0": [ "0" ],
  119714. "I1": [ "0" ],
  119715. "I2": [ "0" ],
  119716. "I3": [ 5176 ],
  119717. "O": [ 5174 ]
  119718. }
  119719. },
  119720. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_18_I3_SB_CARRY_CO": {
  119721. "hide_name": 0,
  119722. "type": "SB_CARRY",
  119723. "parameters": {
  119724. },
  119725. "attributes": {
  119726. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119727. },
  119728. "port_directions": {
  119729. "CI": "input",
  119730. "CO": "output",
  119731. "I0": "input",
  119732. "I1": "input"
  119733. },
  119734. "connections": {
  119735. "CI": [ 5172 ],
  119736. "CO": [ 5175 ],
  119737. "I0": [ 2635 ],
  119738. "I1": [ 5171 ]
  119739. }
  119740. },
  119741. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_19": {
  119742. "hide_name": 0,
  119743. "type": "SB_LUT4",
  119744. "parameters": {
  119745. "LUT_INIT": "1100100110011100"
  119746. },
  119747. "attributes": {
  119748. "module_not_derived": "00000000000000000000000000000001",
  119749. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119750. },
  119751. "port_directions": {
  119752. "I0": "input",
  119753. "I1": "input",
  119754. "I2": "input",
  119755. "I3": "input",
  119756. "O": "output"
  119757. },
  119758. "connections": {
  119759. "I0": [ 4104 ],
  119760. "I1": [ 2645 ],
  119761. "I2": [ 5177 ],
  119762. "I3": [ 5178 ],
  119763. "O": [ 5115 ]
  119764. }
  119765. },
  119766. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_19_I2_SB_LUT4_O": {
  119767. "hide_name": 0,
  119768. "type": "SB_LUT4",
  119769. "parameters": {
  119770. "LUT_INIT": "0000000011111111"
  119771. },
  119772. "attributes": {
  119773. "module_not_derived": "00000000000000000000000000000001",
  119774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119775. },
  119776. "port_directions": {
  119777. "I0": "input",
  119778. "I1": "input",
  119779. "I2": "input",
  119780. "I3": "input",
  119781. "O": "output"
  119782. },
  119783. "connections": {
  119784. "I0": [ "0" ],
  119785. "I1": [ "0" ],
  119786. "I2": [ "0" ],
  119787. "I3": [ 5179 ],
  119788. "O": [ 5177 ]
  119789. }
  119790. },
  119791. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_19_I3_SB_CARRY_CO": {
  119792. "hide_name": 0,
  119793. "type": "SB_CARRY",
  119794. "parameters": {
  119795. },
  119796. "attributes": {
  119797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119798. },
  119799. "port_directions": {
  119800. "CI": "input",
  119801. "CO": "output",
  119802. "I0": "input",
  119803. "I1": "input"
  119804. },
  119805. "connections": {
  119806. "CI": [ 5175 ],
  119807. "CO": [ 5178 ],
  119808. "I0": [ 2640 ],
  119809. "I1": [ 5174 ]
  119810. }
  119811. },
  119812. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_1_I2_SB_LUT4_O": {
  119813. "hide_name": 0,
  119814. "type": "SB_LUT4",
  119815. "parameters": {
  119816. "LUT_INIT": "0000000011111111"
  119817. },
  119818. "attributes": {
  119819. "module_not_derived": "00000000000000000000000000000001",
  119820. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119821. },
  119822. "port_directions": {
  119823. "I0": "input",
  119824. "I1": "input",
  119825. "I2": "input",
  119826. "I3": "input",
  119827. "O": "output"
  119828. },
  119829. "connections": {
  119830. "I0": [ "0" ],
  119831. "I1": [ "0" ],
  119832. "I2": [ "0" ],
  119833. "I3": [ 5180 ],
  119834. "O": [ 5148 ]
  119835. }
  119836. },
  119837. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  119838. "hide_name": 0,
  119839. "type": "SB_CARRY",
  119840. "parameters": {
  119841. },
  119842. "attributes": {
  119843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119844. },
  119845. "port_directions": {
  119846. "CI": "input",
  119847. "CO": "output",
  119848. "I0": "input",
  119849. "I1": "input"
  119850. },
  119851. "connections": {
  119852. "CI": [ 5147 ],
  119853. "CO": [ 5149 ],
  119854. "I0": [ 2717 ],
  119855. "I1": [ 5146 ]
  119856. }
  119857. },
  119858. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_2": {
  119859. "hide_name": 0,
  119860. "type": "SB_LUT4",
  119861. "parameters": {
  119862. "LUT_INIT": "1100100110011100"
  119863. },
  119864. "attributes": {
  119865. "module_not_derived": "00000000000000000000000000000001",
  119866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119867. },
  119868. "port_directions": {
  119869. "I0": "input",
  119870. "I1": "input",
  119871. "I2": "input",
  119872. "I3": "input",
  119873. "O": "output"
  119874. },
  119875. "connections": {
  119876. "I0": [ 4104 ],
  119877. "I1": [ 2711 ],
  119878. "I2": [ 5181 ],
  119879. "I3": [ 5182 ],
  119880. "O": [ 5102 ]
  119881. }
  119882. },
  119883. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_20": {
  119884. "hide_name": 0,
  119885. "type": "SB_LUT4",
  119886. "parameters": {
  119887. "LUT_INIT": "1100100110011100"
  119888. },
  119889. "attributes": {
  119890. "module_not_derived": "00000000000000000000000000000001",
  119891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119892. },
  119893. "port_directions": {
  119894. "I0": "input",
  119895. "I1": "input",
  119896. "I2": "input",
  119897. "I3": "input",
  119898. "O": "output"
  119899. },
  119900. "connections": {
  119901. "I0": [ 4104 ],
  119902. "I1": [ 2650 ],
  119903. "I2": [ 5183 ],
  119904. "I3": [ 5184 ],
  119905. "O": [ 5112 ]
  119906. }
  119907. },
  119908. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_20_I2_SB_LUT4_O": {
  119909. "hide_name": 0,
  119910. "type": "SB_LUT4",
  119911. "parameters": {
  119912. "LUT_INIT": "0000000011111111"
  119913. },
  119914. "attributes": {
  119915. "module_not_derived": "00000000000000000000000000000001",
  119916. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119917. },
  119918. "port_directions": {
  119919. "I0": "input",
  119920. "I1": "input",
  119921. "I2": "input",
  119922. "I3": "input",
  119923. "O": "output"
  119924. },
  119925. "connections": {
  119926. "I0": [ "0" ],
  119927. "I1": [ "0" ],
  119928. "I2": [ "0" ],
  119929. "I3": [ 5185 ],
  119930. "O": [ 5183 ]
  119931. }
  119932. },
  119933. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_20_I3_SB_CARRY_CO": {
  119934. "hide_name": 0,
  119935. "type": "SB_CARRY",
  119936. "parameters": {
  119937. },
  119938. "attributes": {
  119939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  119940. },
  119941. "port_directions": {
  119942. "CI": "input",
  119943. "CO": "output",
  119944. "I0": "input",
  119945. "I1": "input"
  119946. },
  119947. "connections": {
  119948. "CI": [ 5178 ],
  119949. "CO": [ 5184 ],
  119950. "I0": [ 2645 ],
  119951. "I1": [ 5177 ]
  119952. }
  119953. },
  119954. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_21": {
  119955. "hide_name": 0,
  119956. "type": "SB_LUT4",
  119957. "parameters": {
  119958. "LUT_INIT": "1100100110011100"
  119959. },
  119960. "attributes": {
  119961. "module_not_derived": "00000000000000000000000000000001",
  119962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  119963. },
  119964. "port_directions": {
  119965. "I0": "input",
  119966. "I1": "input",
  119967. "I2": "input",
  119968. "I3": "input",
  119969. "O": "output"
  119970. },
  119971. "connections": {
  119972. "I0": [ 4104 ],
  119973. "I1": [ 2719 ],
  119974. "I2": [ 5186 ],
  119975. "I3": [ 5187 ],
  119976. "O": [ 5113 ]
  119977. }
  119978. },
  119979. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_21_I2_SB_LUT4_O": {
  119980. "hide_name": 0,
  119981. "type": "SB_LUT4",
  119982. "parameters": {
  119983. "LUT_INIT": "0000000011111111"
  119984. },
  119985. "attributes": {
  119986. "module_not_derived": "00000000000000000000000000000001",
  119987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  119988. },
  119989. "port_directions": {
  119990. "I0": "input",
  119991. "I1": "input",
  119992. "I2": "input",
  119993. "I3": "input",
  119994. "O": "output"
  119995. },
  119996. "connections": {
  119997. "I0": [ "0" ],
  119998. "I1": [ "0" ],
  119999. "I2": [ "0" ],
  120000. "I3": [ 5188 ],
  120001. "O": [ 5186 ]
  120002. }
  120003. },
  120004. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_21_I3_SB_CARRY_CO": {
  120005. "hide_name": 0,
  120006. "type": "SB_CARRY",
  120007. "parameters": {
  120008. },
  120009. "attributes": {
  120010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120011. },
  120012. "port_directions": {
  120013. "CI": "input",
  120014. "CO": "output",
  120015. "I0": "input",
  120016. "I1": "input"
  120017. },
  120018. "connections": {
  120019. "CI": [ "1" ],
  120020. "CO": [ 5187 ],
  120021. "I0": [ 2752 ],
  120022. "I1": [ 5150 ]
  120023. }
  120024. },
  120025. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_22": {
  120026. "hide_name": 0,
  120027. "type": "SB_LUT4",
  120028. "parameters": {
  120029. "LUT_INIT": "1100100110011100"
  120030. },
  120031. "attributes": {
  120032. "module_not_derived": "00000000000000000000000000000001",
  120033. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120034. },
  120035. "port_directions": {
  120036. "I0": "input",
  120037. "I1": "input",
  120038. "I2": "input",
  120039. "I3": "input",
  120040. "O": "output"
  120041. },
  120042. "connections": {
  120043. "I0": [ 4104 ],
  120044. "I1": [ 2662 ],
  120045. "I2": [ 5189 ],
  120046. "I3": [ 5190 ],
  120047. "O": [ 5101 ]
  120048. }
  120049. },
  120050. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_22_I2_SB_LUT4_O": {
  120051. "hide_name": 0,
  120052. "type": "SB_LUT4",
  120053. "parameters": {
  120054. "LUT_INIT": "0000000011111111"
  120055. },
  120056. "attributes": {
  120057. "module_not_derived": "00000000000000000000000000000001",
  120058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120059. },
  120060. "port_directions": {
  120061. "I0": "input",
  120062. "I1": "input",
  120063. "I2": "input",
  120064. "I3": "input",
  120065. "O": "output"
  120066. },
  120067. "connections": {
  120068. "I0": [ "0" ],
  120069. "I1": [ "0" ],
  120070. "I2": [ "0" ],
  120071. "I3": [ 5191 ],
  120072. "O": [ 5189 ]
  120073. }
  120074. },
  120075. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_22_I3_SB_CARRY_CO": {
  120076. "hide_name": 0,
  120077. "type": "SB_CARRY",
  120078. "parameters": {
  120079. },
  120080. "attributes": {
  120081. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120082. },
  120083. "port_directions": {
  120084. "CI": "input",
  120085. "CO": "output",
  120086. "I0": "input",
  120087. "I1": "input"
  120088. },
  120089. "connections": {
  120090. "CI": [ 5184 ],
  120091. "CO": [ 5190 ],
  120092. "I0": [ 2650 ],
  120093. "I1": [ 5183 ]
  120094. }
  120095. },
  120096. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_23": {
  120097. "hide_name": 0,
  120098. "type": "SB_LUT4",
  120099. "parameters": {
  120100. "LUT_INIT": "1100100110011100"
  120101. },
  120102. "attributes": {
  120103. "module_not_derived": "00000000000000000000000000000001",
  120104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120105. },
  120106. "port_directions": {
  120107. "I0": "input",
  120108. "I1": "input",
  120109. "I2": "input",
  120110. "I3": "input",
  120111. "O": "output"
  120112. },
  120113. "connections": {
  120114. "I0": [ 4104 ],
  120115. "I1": [ 2674 ],
  120116. "I2": [ 5192 ],
  120117. "I3": [ 5193 ],
  120118. "O": [ 5090 ]
  120119. }
  120120. },
  120121. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_23_I2_SB_LUT4_O": {
  120122. "hide_name": 0,
  120123. "type": "SB_LUT4",
  120124. "parameters": {
  120125. "LUT_INIT": "0000000011111111"
  120126. },
  120127. "attributes": {
  120128. "module_not_derived": "00000000000000000000000000000001",
  120129. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120130. },
  120131. "port_directions": {
  120132. "I0": "input",
  120133. "I1": "input",
  120134. "I2": "input",
  120135. "I3": "input",
  120136. "O": "output"
  120137. },
  120138. "connections": {
  120139. "I0": [ "0" ],
  120140. "I1": [ "0" ],
  120141. "I2": [ "0" ],
  120142. "I3": [ 5194 ],
  120143. "O": [ 5192 ]
  120144. }
  120145. },
  120146. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_23_I3_SB_CARRY_CO": {
  120147. "hide_name": 0,
  120148. "type": "SB_CARRY",
  120149. "parameters": {
  120150. },
  120151. "attributes": {
  120152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120153. },
  120154. "port_directions": {
  120155. "CI": "input",
  120156. "CO": "output",
  120157. "I0": "input",
  120158. "I1": "input"
  120159. },
  120160. "connections": {
  120161. "CI": [ 5190 ],
  120162. "CO": [ 5193 ],
  120163. "I0": [ 2662 ],
  120164. "I1": [ 5189 ]
  120165. }
  120166. },
  120167. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24": {
  120168. "hide_name": 0,
  120169. "type": "SB_LUT4",
  120170. "parameters": {
  120171. "LUT_INIT": "1100100110011100"
  120172. },
  120173. "attributes": {
  120174. "module_not_derived": "00000000000000000000000000000001",
  120175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120176. },
  120177. "port_directions": {
  120178. "I0": "input",
  120179. "I1": "input",
  120180. "I2": "input",
  120181. "I3": "input",
  120182. "O": "output"
  120183. },
  120184. "connections": {
  120185. "I0": [ 4104 ],
  120186. "I1": [ 2679 ],
  120187. "I2": [ 5195 ],
  120188. "I3": [ 5196 ],
  120189. "O": [ 5088 ]
  120190. }
  120191. },
  120192. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I2_SB_LUT4_O": {
  120193. "hide_name": 0,
  120194. "type": "SB_LUT4",
  120195. "parameters": {
  120196. "LUT_INIT": "0000000011111111"
  120197. },
  120198. "attributes": {
  120199. "module_not_derived": "00000000000000000000000000000001",
  120200. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120201. },
  120202. "port_directions": {
  120203. "I0": "input",
  120204. "I1": "input",
  120205. "I2": "input",
  120206. "I3": "input",
  120207. "O": "output"
  120208. },
  120209. "connections": {
  120210. "I0": [ "0" ],
  120211. "I1": [ "0" ],
  120212. "I2": [ "0" ],
  120213. "I3": [ 5197 ],
  120214. "O": [ 5195 ]
  120215. }
  120216. },
  120217. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3_SB_CARRY_CI": {
  120218. "hide_name": 0,
  120219. "type": "SB_CARRY",
  120220. "parameters": {
  120221. },
  120222. "attributes": {
  120223. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120224. },
  120225. "port_directions": {
  120226. "CI": "input",
  120227. "CO": "output",
  120228. "I0": "input",
  120229. "I1": "input"
  120230. },
  120231. "connections": {
  120232. "CI": [ 5196 ],
  120233. "CO": [ 5198 ],
  120234. "I0": [ 2679 ],
  120235. "I1": [ 5195 ]
  120236. }
  120237. },
  120238. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3_SB_CARRY_CI_CO_SB_LUT4_I3": {
  120239. "hide_name": 0,
  120240. "type": "SB_LUT4",
  120241. "parameters": {
  120242. "LUT_INIT": "0110100110010110"
  120243. },
  120244. "attributes": {
  120245. "module_not_derived": "00000000000000000000000000000001",
  120246. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120247. },
  120248. "port_directions": {
  120249. "I0": "input",
  120250. "I1": "input",
  120251. "I2": "input",
  120252. "I3": "input",
  120253. "O": "output"
  120254. },
  120255. "connections": {
  120256. "I0": [ "0" ],
  120257. "I1": [ 2751 ],
  120258. "I2": [ "1" ],
  120259. "I3": [ 5198 ],
  120260. "O": [ 4104 ]
  120261. }
  120262. },
  120263. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O": {
  120264. "hide_name": 0,
  120265. "type": "SB_LUT4",
  120266. "parameters": {
  120267. "LUT_INIT": "0000000011111111"
  120268. },
  120269. "attributes": {
  120270. "module_not_derived": "00000000000000000000000000000001",
  120271. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120272. },
  120273. "port_directions": {
  120274. "I0": "input",
  120275. "I1": "input",
  120276. "I2": "input",
  120277. "I3": "input",
  120278. "O": "output"
  120279. },
  120280. "connections": {
  120281. "I0": [ "0" ],
  120282. "I1": [ "0" ],
  120283. "I2": [ "0" ],
  120284. "I3": [ 5199 ],
  120285. "O": [ 5163 ]
  120286. }
  120287. },
  120288. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3_SB_CARRY_CO": {
  120289. "hide_name": 0,
  120290. "type": "SB_CARRY",
  120291. "parameters": {
  120292. },
  120293. "attributes": {
  120294. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120295. },
  120296. "port_directions": {
  120297. "CI": "input",
  120298. "CO": "output",
  120299. "I0": "input",
  120300. "I1": "input"
  120301. },
  120302. "connections": {
  120303. "CI": [ 5193 ],
  120304. "CO": [ 5196 ],
  120305. "I0": [ 2674 ],
  120306. "I1": [ 5192 ]
  120307. }
  120308. },
  120309. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_25": {
  120310. "hide_name": 0,
  120311. "type": "SB_LUT4",
  120312. "parameters": {
  120313. "LUT_INIT": "1100100110011100"
  120314. },
  120315. "attributes": {
  120316. "module_not_derived": "00000000000000000000000000000001",
  120317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120318. },
  120319. "port_directions": {
  120320. "I0": "input",
  120321. "I1": "input",
  120322. "I2": "input",
  120323. "I3": "input",
  120324. "O": "output"
  120325. },
  120326. "connections": {
  120327. "I0": [ 4104 ],
  120328. "I1": [ 2667 ],
  120329. "I2": [ 5200 ],
  120330. "I3": [ 5201 ],
  120331. "O": [ 5111 ]
  120332. }
  120333. },
  120334. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_25_I2_SB_LUT4_O": {
  120335. "hide_name": 0,
  120336. "type": "SB_LUT4",
  120337. "parameters": {
  120338. "LUT_INIT": "0000000011111111"
  120339. },
  120340. "attributes": {
  120341. "module_not_derived": "00000000000000000000000000000001",
  120342. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120343. },
  120344. "port_directions": {
  120345. "I0": "input",
  120346. "I1": "input",
  120347. "I2": "input",
  120348. "I3": "input",
  120349. "O": "output"
  120350. },
  120351. "connections": {
  120352. "I0": [ "0" ],
  120353. "I1": [ "0" ],
  120354. "I2": [ "0" ],
  120355. "I3": [ 5202 ],
  120356. "O": [ 5200 ]
  120357. }
  120358. },
  120359. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_25_I3_SB_CARRY_CO": {
  120360. "hide_name": 0,
  120361. "type": "SB_CARRY",
  120362. "parameters": {
  120363. },
  120364. "attributes": {
  120365. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120366. },
  120367. "port_directions": {
  120368. "CI": "input",
  120369. "CO": "output",
  120370. "I0": "input",
  120371. "I1": "input"
  120372. },
  120373. "connections": {
  120374. "CI": [ 5187 ],
  120375. "CO": [ 5201 ],
  120376. "I0": [ 2719 ],
  120377. "I1": [ 5186 ]
  120378. }
  120379. },
  120380. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_26": {
  120381. "hide_name": 0,
  120382. "type": "SB_LUT4",
  120383. "parameters": {
  120384. "LUT_INIT": "1100100110011100"
  120385. },
  120386. "attributes": {
  120387. "module_not_derived": "00000000000000000000000000000001",
  120388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120389. },
  120390. "port_directions": {
  120391. "I0": "input",
  120392. "I1": "input",
  120393. "I2": "input",
  120394. "I3": "input",
  120395. "O": "output"
  120396. },
  120397. "connections": {
  120398. "I0": [ 4104 ],
  120399. "I1": [ 2684 ],
  120400. "I2": [ 5203 ],
  120401. "I3": [ 5204 ],
  120402. "O": [ 5110 ]
  120403. }
  120404. },
  120405. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_26_I2_SB_LUT4_O": {
  120406. "hide_name": 0,
  120407. "type": "SB_LUT4",
  120408. "parameters": {
  120409. "LUT_INIT": "0000000011111111"
  120410. },
  120411. "attributes": {
  120412. "module_not_derived": "00000000000000000000000000000001",
  120413. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120414. },
  120415. "port_directions": {
  120416. "I0": "input",
  120417. "I1": "input",
  120418. "I2": "input",
  120419. "I3": "input",
  120420. "O": "output"
  120421. },
  120422. "connections": {
  120423. "I0": [ "0" ],
  120424. "I1": [ "0" ],
  120425. "I2": [ "0" ],
  120426. "I3": [ 5205 ],
  120427. "O": [ 5203 ]
  120428. }
  120429. },
  120430. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_26_I3_SB_CARRY_CO": {
  120431. "hide_name": 0,
  120432. "type": "SB_CARRY",
  120433. "parameters": {
  120434. },
  120435. "attributes": {
  120436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120437. },
  120438. "port_directions": {
  120439. "CI": "input",
  120440. "CO": "output",
  120441. "I0": "input",
  120442. "I1": "input"
  120443. },
  120444. "connections": {
  120445. "CI": [ 5201 ],
  120446. "CO": [ 5204 ],
  120447. "I0": [ 2667 ],
  120448. "I1": [ 5200 ]
  120449. }
  120450. },
  120451. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_27": {
  120452. "hide_name": 0,
  120453. "type": "SB_LUT4",
  120454. "parameters": {
  120455. "LUT_INIT": "1100100110011100"
  120456. },
  120457. "attributes": {
  120458. "module_not_derived": "00000000000000000000000000000001",
  120459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120460. },
  120461. "port_directions": {
  120462. "I0": "input",
  120463. "I1": "input",
  120464. "I2": "input",
  120465. "I3": "input",
  120466. "O": "output"
  120467. },
  120468. "connections": {
  120469. "I0": [ 4104 ],
  120470. "I1": [ 2689 ],
  120471. "I2": [ 5206 ],
  120472. "I3": [ 5207 ],
  120473. "O": [ 5109 ]
  120474. }
  120475. },
  120476. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_27_I2_SB_LUT4_O": {
  120477. "hide_name": 0,
  120478. "type": "SB_LUT4",
  120479. "parameters": {
  120480. "LUT_INIT": "0000000011111111"
  120481. },
  120482. "attributes": {
  120483. "module_not_derived": "00000000000000000000000000000001",
  120484. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120485. },
  120486. "port_directions": {
  120487. "I0": "input",
  120488. "I1": "input",
  120489. "I2": "input",
  120490. "I3": "input",
  120491. "O": "output"
  120492. },
  120493. "connections": {
  120494. "I0": [ "0" ],
  120495. "I1": [ "0" ],
  120496. "I2": [ "0" ],
  120497. "I3": [ 5208 ],
  120498. "O": [ 5206 ]
  120499. }
  120500. },
  120501. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_27_I3_SB_CARRY_CO": {
  120502. "hide_name": 0,
  120503. "type": "SB_CARRY",
  120504. "parameters": {
  120505. },
  120506. "attributes": {
  120507. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120508. },
  120509. "port_directions": {
  120510. "CI": "input",
  120511. "CO": "output",
  120512. "I0": "input",
  120513. "I1": "input"
  120514. },
  120515. "connections": {
  120516. "CI": [ 5204 ],
  120517. "CO": [ 5207 ],
  120518. "I0": [ 2684 ],
  120519. "I1": [ 5203 ]
  120520. }
  120521. },
  120522. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_28": {
  120523. "hide_name": 0,
  120524. "type": "SB_LUT4",
  120525. "parameters": {
  120526. "LUT_INIT": "1100100110011100"
  120527. },
  120528. "attributes": {
  120529. "module_not_derived": "00000000000000000000000000000001",
  120530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120531. },
  120532. "port_directions": {
  120533. "I0": "input",
  120534. "I1": "input",
  120535. "I2": "input",
  120536. "I3": "input",
  120537. "O": "output"
  120538. },
  120539. "connections": {
  120540. "I0": [ 4104 ],
  120541. "I1": [ 2694 ],
  120542. "I2": [ 5209 ],
  120543. "I3": [ 5210 ],
  120544. "O": [ 5108 ]
  120545. }
  120546. },
  120547. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_28_I2_SB_LUT4_O": {
  120548. "hide_name": 0,
  120549. "type": "SB_LUT4",
  120550. "parameters": {
  120551. "LUT_INIT": "0000000011111111"
  120552. },
  120553. "attributes": {
  120554. "module_not_derived": "00000000000000000000000000000001",
  120555. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120556. },
  120557. "port_directions": {
  120558. "I0": "input",
  120559. "I1": "input",
  120560. "I2": "input",
  120561. "I3": "input",
  120562. "O": "output"
  120563. },
  120564. "connections": {
  120565. "I0": [ "0" ],
  120566. "I1": [ "0" ],
  120567. "I2": [ "0" ],
  120568. "I3": [ 5211 ],
  120569. "O": [ 5209 ]
  120570. }
  120571. },
  120572. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_28_I3_SB_CARRY_CO": {
  120573. "hide_name": 0,
  120574. "type": "SB_CARRY",
  120575. "parameters": {
  120576. },
  120577. "attributes": {
  120578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120579. },
  120580. "port_directions": {
  120581. "CI": "input",
  120582. "CO": "output",
  120583. "I0": "input",
  120584. "I1": "input"
  120585. },
  120586. "connections": {
  120587. "CI": [ 5207 ],
  120588. "CO": [ 5210 ],
  120589. "I0": [ 2689 ],
  120590. "I1": [ 5206 ]
  120591. }
  120592. },
  120593. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_29": {
  120594. "hide_name": 0,
  120595. "type": "SB_LUT4",
  120596. "parameters": {
  120597. "LUT_INIT": "1100100110011100"
  120598. },
  120599. "attributes": {
  120600. "module_not_derived": "00000000000000000000000000000001",
  120601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120602. },
  120603. "port_directions": {
  120604. "I0": "input",
  120605. "I1": "input",
  120606. "I2": "input",
  120607. "I3": "input",
  120608. "O": "output"
  120609. },
  120610. "connections": {
  120611. "I0": [ 4104 ],
  120612. "I1": [ 2699 ],
  120613. "I2": [ 5212 ],
  120614. "I3": [ 5213 ],
  120615. "O": [ 5107 ]
  120616. }
  120617. },
  120618. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_29_I2_SB_LUT4_O": {
  120619. "hide_name": 0,
  120620. "type": "SB_LUT4",
  120621. "parameters": {
  120622. "LUT_INIT": "0000000011111111"
  120623. },
  120624. "attributes": {
  120625. "module_not_derived": "00000000000000000000000000000001",
  120626. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120627. },
  120628. "port_directions": {
  120629. "I0": "input",
  120630. "I1": "input",
  120631. "I2": "input",
  120632. "I3": "input",
  120633. "O": "output"
  120634. },
  120635. "connections": {
  120636. "I0": [ "0" ],
  120637. "I1": [ "0" ],
  120638. "I2": [ "0" ],
  120639. "I3": [ 5214 ],
  120640. "O": [ 5212 ]
  120641. }
  120642. },
  120643. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_29_I3_SB_CARRY_CO": {
  120644. "hide_name": 0,
  120645. "type": "SB_CARRY",
  120646. "parameters": {
  120647. },
  120648. "attributes": {
  120649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120650. },
  120651. "port_directions": {
  120652. "CI": "input",
  120653. "CO": "output",
  120654. "I0": "input",
  120655. "I1": "input"
  120656. },
  120657. "connections": {
  120658. "CI": [ 5210 ],
  120659. "CO": [ 5213 ],
  120660. "I0": [ 2694 ],
  120661. "I1": [ 5209 ]
  120662. }
  120663. },
  120664. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_2_I2_SB_LUT4_O": {
  120665. "hide_name": 0,
  120666. "type": "SB_LUT4",
  120667. "parameters": {
  120668. "LUT_INIT": "0000000011111111"
  120669. },
  120670. "attributes": {
  120671. "module_not_derived": "00000000000000000000000000000001",
  120672. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120673. },
  120674. "port_directions": {
  120675. "I0": "input",
  120676. "I1": "input",
  120677. "I2": "input",
  120678. "I3": "input",
  120679. "O": "output"
  120680. },
  120681. "connections": {
  120682. "I0": [ "0" ],
  120683. "I1": [ "0" ],
  120684. "I2": [ "0" ],
  120685. "I3": [ 5215 ],
  120686. "O": [ 5181 ]
  120687. }
  120688. },
  120689. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  120690. "hide_name": 0,
  120691. "type": "SB_CARRY",
  120692. "parameters": {
  120693. },
  120694. "attributes": {
  120695. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120696. },
  120697. "port_directions": {
  120698. "CI": "input",
  120699. "CO": "output",
  120700. "I0": "input",
  120701. "I1": "input"
  120702. },
  120703. "connections": {
  120704. "CI": [ 5149 ],
  120705. "CO": [ 5182 ],
  120706. "I0": [ 2652 ],
  120707. "I1": [ 5148 ]
  120708. }
  120709. },
  120710. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_3": {
  120711. "hide_name": 0,
  120712. "type": "SB_LUT4",
  120713. "parameters": {
  120714. "LUT_INIT": "1100100110011100"
  120715. },
  120716. "attributes": {
  120717. "module_not_derived": "00000000000000000000000000000001",
  120718. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120719. },
  120720. "port_directions": {
  120721. "I0": "input",
  120722. "I1": "input",
  120723. "I2": "input",
  120724. "I3": "input",
  120725. "O": "output"
  120726. },
  120727. "connections": {
  120728. "I0": [ 4104 ],
  120729. "I1": [ 2721 ],
  120730. "I2": [ 5216 ],
  120731. "I3": [ 5217 ],
  120732. "O": [ 5100 ]
  120733. }
  120734. },
  120735. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_30": {
  120736. "hide_name": 0,
  120737. "type": "SB_LUT4",
  120738. "parameters": {
  120739. "LUT_INIT": "1100100110011100"
  120740. },
  120741. "attributes": {
  120742. "module_not_derived": "00000000000000000000000000000001",
  120743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120744. },
  120745. "port_directions": {
  120746. "I0": "input",
  120747. "I1": "input",
  120748. "I2": "input",
  120749. "I3": "input",
  120750. "O": "output"
  120751. },
  120752. "connections": {
  120753. "I0": [ 4104 ],
  120754. "I1": [ 2704 ],
  120755. "I2": [ 5218 ],
  120756. "I3": [ 5219 ],
  120757. "O": [ 5106 ]
  120758. }
  120759. },
  120760. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_30_I2_SB_LUT4_O": {
  120761. "hide_name": 0,
  120762. "type": "SB_LUT4",
  120763. "parameters": {
  120764. "LUT_INIT": "0000000011111111"
  120765. },
  120766. "attributes": {
  120767. "module_not_derived": "00000000000000000000000000000001",
  120768. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120769. },
  120770. "port_directions": {
  120771. "I0": "input",
  120772. "I1": "input",
  120773. "I2": "input",
  120774. "I3": "input",
  120775. "O": "output"
  120776. },
  120777. "connections": {
  120778. "I0": [ "0" ],
  120779. "I1": [ "0" ],
  120780. "I2": [ "0" ],
  120781. "I3": [ 5220 ],
  120782. "O": [ 5218 ]
  120783. }
  120784. },
  120785. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_30_I3_SB_CARRY_CO": {
  120786. "hide_name": 0,
  120787. "type": "SB_CARRY",
  120788. "parameters": {
  120789. },
  120790. "attributes": {
  120791. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120792. },
  120793. "port_directions": {
  120794. "CI": "input",
  120795. "CO": "output",
  120796. "I0": "input",
  120797. "I1": "input"
  120798. },
  120799. "connections": {
  120800. "CI": [ 5213 ],
  120801. "CO": [ 5219 ],
  120802. "I0": [ 2699 ],
  120803. "I1": [ 5212 ]
  120804. }
  120805. },
  120806. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_31": {
  120807. "hide_name": 0,
  120808. "type": "SB_LUT4",
  120809. "parameters": {
  120810. "LUT_INIT": "1100100110011100"
  120811. },
  120812. "attributes": {
  120813. "module_not_derived": "00000000000000000000000000000001",
  120814. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120815. },
  120816. "port_directions": {
  120817. "I0": "input",
  120818. "I1": "input",
  120819. "I2": "input",
  120820. "I3": "input",
  120821. "O": "output"
  120822. },
  120823. "connections": {
  120824. "I0": [ 4104 ],
  120825. "I1": [ 2709 ],
  120826. "I2": [ 5221 ],
  120827. "I3": [ 5222 ],
  120828. "O": [ 5105 ]
  120829. }
  120830. },
  120831. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_31_I2_SB_LUT4_O": {
  120832. "hide_name": 0,
  120833. "type": "SB_LUT4",
  120834. "parameters": {
  120835. "LUT_INIT": "0000000011111111"
  120836. },
  120837. "attributes": {
  120838. "module_not_derived": "00000000000000000000000000000001",
  120839. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120840. },
  120841. "port_directions": {
  120842. "I0": "input",
  120843. "I1": "input",
  120844. "I2": "input",
  120845. "I3": "input",
  120846. "O": "output"
  120847. },
  120848. "connections": {
  120849. "I0": [ "0" ],
  120850. "I1": [ "0" ],
  120851. "I2": [ "0" ],
  120852. "I3": [ 5223 ],
  120853. "O": [ 5221 ]
  120854. }
  120855. },
  120856. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_31_I3_SB_CARRY_CO": {
  120857. "hide_name": 0,
  120858. "type": "SB_CARRY",
  120859. "parameters": {
  120860. },
  120861. "attributes": {
  120862. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120863. },
  120864. "port_directions": {
  120865. "CI": "input",
  120866. "CO": "output",
  120867. "I0": "input",
  120868. "I1": "input"
  120869. },
  120870. "connections": {
  120871. "CI": [ 5219 ],
  120872. "CO": [ 5222 ],
  120873. "I0": [ 2704 ],
  120874. "I1": [ 5218 ]
  120875. }
  120876. },
  120877. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_3_I2_SB_LUT4_O": {
  120878. "hide_name": 0,
  120879. "type": "SB_LUT4",
  120880. "parameters": {
  120881. "LUT_INIT": "0000000011111111"
  120882. },
  120883. "attributes": {
  120884. "module_not_derived": "00000000000000000000000000000001",
  120885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120886. },
  120887. "port_directions": {
  120888. "I0": "input",
  120889. "I1": "input",
  120890. "I2": "input",
  120891. "I3": "input",
  120892. "O": "output"
  120893. },
  120894. "connections": {
  120895. "I0": [ "0" ],
  120896. "I1": [ "0" ],
  120897. "I2": [ "0" ],
  120898. "I3": [ 5224 ],
  120899. "O": [ 5216 ]
  120900. }
  120901. },
  120902. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  120903. "hide_name": 0,
  120904. "type": "SB_CARRY",
  120905. "parameters": {
  120906. },
  120907. "attributes": {
  120908. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120909. },
  120910. "port_directions": {
  120911. "CI": "input",
  120912. "CO": "output",
  120913. "I0": "input",
  120914. "I1": "input"
  120915. },
  120916. "connections": {
  120917. "CI": [ 5182 ],
  120918. "CO": [ 5217 ],
  120919. "I0": [ 2711 ],
  120920. "I1": [ 5181 ]
  120921. }
  120922. },
  120923. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_4": {
  120924. "hide_name": 0,
  120925. "type": "SB_LUT4",
  120926. "parameters": {
  120927. "LUT_INIT": "1100100110011100"
  120928. },
  120929. "attributes": {
  120930. "module_not_derived": "00000000000000000000000000000001",
  120931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  120932. },
  120933. "port_directions": {
  120934. "I0": "input",
  120935. "I1": "input",
  120936. "I2": "input",
  120937. "I3": "input",
  120938. "O": "output"
  120939. },
  120940. "connections": {
  120941. "I0": [ 4104 ],
  120942. "I1": [ 2726 ],
  120943. "I2": [ 5225 ],
  120944. "I3": [ 5226 ],
  120945. "O": [ 5099 ]
  120946. }
  120947. },
  120948. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_4_I2_SB_LUT4_O": {
  120949. "hide_name": 0,
  120950. "type": "SB_LUT4",
  120951. "parameters": {
  120952. "LUT_INIT": "0000000011111111"
  120953. },
  120954. "attributes": {
  120955. "module_not_derived": "00000000000000000000000000000001",
  120956. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  120957. },
  120958. "port_directions": {
  120959. "I0": "input",
  120960. "I1": "input",
  120961. "I2": "input",
  120962. "I3": "input",
  120963. "O": "output"
  120964. },
  120965. "connections": {
  120966. "I0": [ "0" ],
  120967. "I1": [ "0" ],
  120968. "I2": [ "0" ],
  120969. "I3": [ 5227 ],
  120970. "O": [ 5225 ]
  120971. }
  120972. },
  120973. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  120974. "hide_name": 0,
  120975. "type": "SB_CARRY",
  120976. "parameters": {
  120977. },
  120978. "attributes": {
  120979. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  120980. },
  120981. "port_directions": {
  120982. "CI": "input",
  120983. "CO": "output",
  120984. "I0": "input",
  120985. "I1": "input"
  120986. },
  120987. "connections": {
  120988. "CI": [ 5217 ],
  120989. "CO": [ 5226 ],
  120990. "I0": [ 2721 ],
  120991. "I1": [ 5216 ]
  120992. }
  120993. },
  120994. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_5": {
  120995. "hide_name": 0,
  120996. "type": "SB_LUT4",
  120997. "parameters": {
  120998. "LUT_INIT": "1100100110011100"
  120999. },
  121000. "attributes": {
  121001. "module_not_derived": "00000000000000000000000000000001",
  121002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  121003. },
  121004. "port_directions": {
  121005. "I0": "input",
  121006. "I1": "input",
  121007. "I2": "input",
  121008. "I3": "input",
  121009. "O": "output"
  121010. },
  121011. "connections": {
  121012. "I0": [ 4104 ],
  121013. "I1": [ 2731 ],
  121014. "I2": [ 5228 ],
  121015. "I3": [ 5229 ],
  121016. "O": [ 5098 ]
  121017. }
  121018. },
  121019. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_5_I2_SB_LUT4_O": {
  121020. "hide_name": 0,
  121021. "type": "SB_LUT4",
  121022. "parameters": {
  121023. "LUT_INIT": "0000000011111111"
  121024. },
  121025. "attributes": {
  121026. "module_not_derived": "00000000000000000000000000000001",
  121027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  121028. },
  121029. "port_directions": {
  121030. "I0": "input",
  121031. "I1": "input",
  121032. "I2": "input",
  121033. "I3": "input",
  121034. "O": "output"
  121035. },
  121036. "connections": {
  121037. "I0": [ "0" ],
  121038. "I1": [ "0" ],
  121039. "I2": [ "0" ],
  121040. "I3": [ 5230 ],
  121041. "O": [ 5228 ]
  121042. }
  121043. },
  121044. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  121045. "hide_name": 0,
  121046. "type": "SB_CARRY",
  121047. "parameters": {
  121048. },
  121049. "attributes": {
  121050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  121051. },
  121052. "port_directions": {
  121053. "CI": "input",
  121054. "CO": "output",
  121055. "I0": "input",
  121056. "I1": "input"
  121057. },
  121058. "connections": {
  121059. "CI": [ 5226 ],
  121060. "CO": [ 5229 ],
  121061. "I0": [ 2726 ],
  121062. "I1": [ 5225 ]
  121063. }
  121064. },
  121065. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_6": {
  121066. "hide_name": 0,
  121067. "type": "SB_LUT4",
  121068. "parameters": {
  121069. "LUT_INIT": "1100100110011100"
  121070. },
  121071. "attributes": {
  121072. "module_not_derived": "00000000000000000000000000000001",
  121073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  121074. },
  121075. "port_directions": {
  121076. "I0": "input",
  121077. "I1": "input",
  121078. "I2": "input",
  121079. "I3": "input",
  121080. "O": "output"
  121081. },
  121082. "connections": {
  121083. "I0": [ 4104 ],
  121084. "I1": [ 2736 ],
  121085. "I2": [ 5231 ],
  121086. "I3": [ 5232 ],
  121087. "O": [ 5097 ]
  121088. }
  121089. },
  121090. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_6_I2_SB_LUT4_O": {
  121091. "hide_name": 0,
  121092. "type": "SB_LUT4",
  121093. "parameters": {
  121094. "LUT_INIT": "0000000011111111"
  121095. },
  121096. "attributes": {
  121097. "module_not_derived": "00000000000000000000000000000001",
  121098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  121099. },
  121100. "port_directions": {
  121101. "I0": "input",
  121102. "I1": "input",
  121103. "I2": "input",
  121104. "I3": "input",
  121105. "O": "output"
  121106. },
  121107. "connections": {
  121108. "I0": [ "0" ],
  121109. "I1": [ "0" ],
  121110. "I2": [ "0" ],
  121111. "I3": [ 5233 ],
  121112. "O": [ 5231 ]
  121113. }
  121114. },
  121115. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  121116. "hide_name": 0,
  121117. "type": "SB_CARRY",
  121118. "parameters": {
  121119. },
  121120. "attributes": {
  121121. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  121122. },
  121123. "port_directions": {
  121124. "CI": "input",
  121125. "CO": "output",
  121126. "I0": "input",
  121127. "I1": "input"
  121128. },
  121129. "connections": {
  121130. "CI": [ 5229 ],
  121131. "CO": [ 5232 ],
  121132. "I0": [ 2731 ],
  121133. "I1": [ 5228 ]
  121134. }
  121135. },
  121136. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_7": {
  121137. "hide_name": 0,
  121138. "type": "SB_LUT4",
  121139. "parameters": {
  121140. "LUT_INIT": "1100100110011100"
  121141. },
  121142. "attributes": {
  121143. "module_not_derived": "00000000000000000000000000000001",
  121144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  121145. },
  121146. "port_directions": {
  121147. "I0": "input",
  121148. "I1": "input",
  121149. "I2": "input",
  121150. "I3": "input",
  121151. "O": "output"
  121152. },
  121153. "connections": {
  121154. "I0": [ 4104 ],
  121155. "I1": [ 2741 ],
  121156. "I2": [ 5234 ],
  121157. "I3": [ 5235 ],
  121158. "O": [ 5096 ]
  121159. }
  121160. },
  121161. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_7_I2_SB_LUT4_O": {
  121162. "hide_name": 0,
  121163. "type": "SB_LUT4",
  121164. "parameters": {
  121165. "LUT_INIT": "0000000011111111"
  121166. },
  121167. "attributes": {
  121168. "module_not_derived": "00000000000000000000000000000001",
  121169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  121170. },
  121171. "port_directions": {
  121172. "I0": "input",
  121173. "I1": "input",
  121174. "I2": "input",
  121175. "I3": "input",
  121176. "O": "output"
  121177. },
  121178. "connections": {
  121179. "I0": [ "0" ],
  121180. "I1": [ "0" ],
  121181. "I2": [ "0" ],
  121182. "I3": [ 5236 ],
  121183. "O": [ 5234 ]
  121184. }
  121185. },
  121186. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  121187. "hide_name": 0,
  121188. "type": "SB_CARRY",
  121189. "parameters": {
  121190. },
  121191. "attributes": {
  121192. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  121193. },
  121194. "port_directions": {
  121195. "CI": "input",
  121196. "CO": "output",
  121197. "I0": "input",
  121198. "I1": "input"
  121199. },
  121200. "connections": {
  121201. "CI": [ 5232 ],
  121202. "CO": [ 5235 ],
  121203. "I0": [ 2736 ],
  121204. "I1": [ 5231 ]
  121205. }
  121206. },
  121207. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_8": {
  121208. "hide_name": 0,
  121209. "type": "SB_LUT4",
  121210. "parameters": {
  121211. "LUT_INIT": "1100100110011100"
  121212. },
  121213. "attributes": {
  121214. "module_not_derived": "00000000000000000000000000000001",
  121215. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  121216. },
  121217. "port_directions": {
  121218. "I0": "input",
  121219. "I1": "input",
  121220. "I2": "input",
  121221. "I3": "input",
  121222. "O": "output"
  121223. },
  121224. "connections": {
  121225. "I0": [ 4104 ],
  121226. "I1": [ 2746 ],
  121227. "I2": [ 5237 ],
  121228. "I3": [ 5238 ],
  121229. "O": [ 5095 ]
  121230. }
  121231. },
  121232. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_8_I2_SB_LUT4_O": {
  121233. "hide_name": 0,
  121234. "type": "SB_LUT4",
  121235. "parameters": {
  121236. "LUT_INIT": "0000000011111111"
  121237. },
  121238. "attributes": {
  121239. "module_not_derived": "00000000000000000000000000000001",
  121240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  121241. },
  121242. "port_directions": {
  121243. "I0": "input",
  121244. "I1": "input",
  121245. "I2": "input",
  121246. "I3": "input",
  121247. "O": "output"
  121248. },
  121249. "connections": {
  121250. "I0": [ "0" ],
  121251. "I1": [ "0" ],
  121252. "I2": [ "0" ],
  121253. "I3": [ 5239 ],
  121254. "O": [ 5237 ]
  121255. }
  121256. },
  121257. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  121258. "hide_name": 0,
  121259. "type": "SB_CARRY",
  121260. "parameters": {
  121261. },
  121262. "attributes": {
  121263. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  121264. },
  121265. "port_directions": {
  121266. "CI": "input",
  121267. "CO": "output",
  121268. "I0": "input",
  121269. "I1": "input"
  121270. },
  121271. "connections": {
  121272. "CI": [ 5235 ],
  121273. "CO": [ 5238 ],
  121274. "I0": [ 2741 ],
  121275. "I1": [ 5234 ]
  121276. }
  121277. },
  121278. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_9": {
  121279. "hide_name": 0,
  121280. "type": "SB_LUT4",
  121281. "parameters": {
  121282. "LUT_INIT": "1100100110011100"
  121283. },
  121284. "attributes": {
  121285. "module_not_derived": "00000000000000000000000000000001",
  121286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  121287. },
  121288. "port_directions": {
  121289. "I0": "input",
  121290. "I1": "input",
  121291. "I2": "input",
  121292. "I3": "input",
  121293. "O": "output"
  121294. },
  121295. "connections": {
  121296. "I0": [ 4104 ],
  121297. "I1": [ 2749 ],
  121298. "I2": [ 5156 ],
  121299. "I3": [ 5155 ],
  121300. "O": [ 5094 ]
  121301. }
  121302. },
  121303. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_9_I2_SB_LUT4_O": {
  121304. "hide_name": 0,
  121305. "type": "SB_LUT4",
  121306. "parameters": {
  121307. "LUT_INIT": "0000000011111111"
  121308. },
  121309. "attributes": {
  121310. "module_not_derived": "00000000000000000000000000000001",
  121311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  121312. },
  121313. "port_directions": {
  121314. "I0": "input",
  121315. "I1": "input",
  121316. "I2": "input",
  121317. "I3": "input",
  121318. "O": "output"
  121319. },
  121320. "connections": {
  121321. "I0": [ "0" ],
  121322. "I1": [ "0" ],
  121323. "I2": [ "0" ],
  121324. "I3": [ 5240 ],
  121325. "O": [ 5156 ]
  121326. }
  121327. },
  121328. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  121329. "hide_name": 0,
  121330. "type": "SB_CARRY",
  121331. "parameters": {
  121332. },
  121333. "attributes": {
  121334. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  121335. },
  121336. "port_directions": {
  121337. "CI": "input",
  121338. "CO": "output",
  121339. "I0": "input",
  121340. "I1": "input"
  121341. },
  121342. "connections": {
  121343. "CI": [ 5238 ],
  121344. "CO": [ 5155 ],
  121345. "I0": [ 2746 ],
  121346. "I1": [ 5237 ]
  121347. }
  121348. },
  121349. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_I2_SB_LUT4_O": {
  121350. "hide_name": 0,
  121351. "type": "SB_LUT4",
  121352. "parameters": {
  121353. "LUT_INIT": "0000000011111111"
  121354. },
  121355. "attributes": {
  121356. "module_not_derived": "00000000000000000000000000000001",
  121357. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  121358. },
  121359. "port_directions": {
  121360. "I0": "input",
  121361. "I1": "input",
  121362. "I2": "input",
  121363. "I3": "input",
  121364. "O": "output"
  121365. },
  121366. "connections": {
  121367. "I0": [ "0" ],
  121368. "I1": [ "0" ],
  121369. "I2": [ "0" ],
  121370. "I3": [ 5241 ],
  121371. "O": [ 5146 ]
  121372. }
  121373. },
  121374. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_I3_SB_CARRY_CO": {
  121375. "hide_name": 0,
  121376. "type": "SB_CARRY",
  121377. "parameters": {
  121378. },
  121379. "attributes": {
  121380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  121381. },
  121382. "port_directions": {
  121383. "CI": "input",
  121384. "CO": "output",
  121385. "I0": "input",
  121386. "I1": "input"
  121387. },
  121388. "connections": {
  121389. "CI": [ 5222 ],
  121390. "CO": [ 5147 ],
  121391. "I0": [ 2709 ],
  121392. "I1": [ 5221 ]
  121393. }
  121394. },
  121395. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q": {
  121396. "hide_name": 0,
  121397. "type": "SB_DFFE",
  121398. "parameters": {
  121399. },
  121400. "attributes": {
  121401. "module_not_derived": "00000000000000000000000000000001",
  121402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121403. },
  121404. "port_directions": {
  121405. "C": "input",
  121406. "D": "input",
  121407. "E": "input",
  121408. "Q": "output"
  121409. },
  121410. "connections": {
  121411. "C": [ 42 ],
  121412. "D": [ 3989 ],
  121413. "E": [ 5089 ],
  121414. "Q": [ 2752 ]
  121415. }
  121416. },
  121417. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_1": {
  121418. "hide_name": 0,
  121419. "type": "SB_DFFE",
  121420. "parameters": {
  121421. },
  121422. "attributes": {
  121423. "module_not_derived": "00000000000000000000000000000001",
  121424. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121425. },
  121426. "port_directions": {
  121427. "C": "input",
  121428. "D": "input",
  121429. "E": "input",
  121430. "Q": "output"
  121431. },
  121432. "connections": {
  121433. "C": [ 42 ],
  121434. "D": [ 4128 ],
  121435. "E": [ 5089 ],
  121436. "Q": [ 2680 ]
  121437. }
  121438. },
  121439. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_10": {
  121440. "hide_name": 0,
  121441. "type": "SB_DFFE",
  121442. "parameters": {
  121443. },
  121444. "attributes": {
  121445. "module_not_derived": "00000000000000000000000000000001",
  121446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121447. },
  121448. "port_directions": {
  121449. "C": "input",
  121450. "D": "input",
  121451. "E": "input",
  121452. "Q": "output"
  121453. },
  121454. "connections": {
  121455. "C": [ 42 ],
  121456. "D": [ 4037 ],
  121457. "E": [ 5089 ],
  121458. "Q": [ 2621 ]
  121459. }
  121460. },
  121461. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_11": {
  121462. "hide_name": 0,
  121463. "type": "SB_DFFE",
  121464. "parameters": {
  121465. },
  121466. "attributes": {
  121467. "module_not_derived": "00000000000000000000000000000001",
  121468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121469. },
  121470. "port_directions": {
  121471. "C": "input",
  121472. "D": "input",
  121473. "E": "input",
  121474. "Q": "output"
  121475. },
  121476. "connections": {
  121477. "C": [ 42 ],
  121478. "D": [ 4042 ],
  121479. "E": [ 5089 ],
  121480. "Q": [ 2616 ]
  121481. }
  121482. },
  121483. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_12": {
  121484. "hide_name": 0,
  121485. "type": "SB_DFFE",
  121486. "parameters": {
  121487. },
  121488. "attributes": {
  121489. "module_not_derived": "00000000000000000000000000000001",
  121490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121491. },
  121492. "port_directions": {
  121493. "C": "input",
  121494. "D": "input",
  121495. "E": "input",
  121496. "Q": "output"
  121497. },
  121498. "connections": {
  121499. "C": [ 42 ],
  121500. "D": [ 4053 ],
  121501. "E": [ 5089 ],
  121502. "Q": [ 2611 ]
  121503. }
  121504. },
  121505. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_13": {
  121506. "hide_name": 0,
  121507. "type": "SB_DFFE",
  121508. "parameters": {
  121509. },
  121510. "attributes": {
  121511. "module_not_derived": "00000000000000000000000000000001",
  121512. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121513. },
  121514. "port_directions": {
  121515. "C": "input",
  121516. "D": "input",
  121517. "E": "input",
  121518. "Q": "output"
  121519. },
  121520. "connections": {
  121521. "C": [ 42 ],
  121522. "D": [ 4058 ],
  121523. "E": [ 5089 ],
  121524. "Q": [ 2603 ]
  121525. }
  121526. },
  121527. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_14": {
  121528. "hide_name": 0,
  121529. "type": "SB_DFFE",
  121530. "parameters": {
  121531. },
  121532. "attributes": {
  121533. "module_not_derived": "00000000000000000000000000000001",
  121534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121535. },
  121536. "port_directions": {
  121537. "C": "input",
  121538. "D": "input",
  121539. "E": "input",
  121540. "Q": "output"
  121541. },
  121542. "connections": {
  121543. "C": [ 42 ],
  121544. "D": [ 4063 ],
  121545. "E": [ 5089 ],
  121546. "Q": [ 2750 ]
  121547. }
  121548. },
  121549. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_15": {
  121550. "hide_name": 0,
  121551. "type": "SB_DFFE",
  121552. "parameters": {
  121553. },
  121554. "attributes": {
  121555. "module_not_derived": "00000000000000000000000000000001",
  121556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121557. },
  121558. "port_directions": {
  121559. "C": "input",
  121560. "D": "input",
  121561. "E": "input",
  121562. "Q": "output"
  121563. },
  121564. "connections": {
  121565. "C": [ 42 ],
  121566. "D": [ 4068 ],
  121567. "E": [ 5089 ],
  121568. "Q": [ 2747 ]
  121569. }
  121570. },
  121571. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_16": {
  121572. "hide_name": 0,
  121573. "type": "SB_DFFE",
  121574. "parameters": {
  121575. },
  121576. "attributes": {
  121577. "module_not_derived": "00000000000000000000000000000001",
  121578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121579. },
  121580. "port_directions": {
  121581. "C": "input",
  121582. "D": "input",
  121583. "E": "input",
  121584. "Q": "output"
  121585. },
  121586. "connections": {
  121587. "C": [ 42 ],
  121588. "D": [ 4073 ],
  121589. "E": [ 5089 ],
  121590. "Q": [ 2742 ]
  121591. }
  121592. },
  121593. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_17": {
  121594. "hide_name": 0,
  121595. "type": "SB_DFFE",
  121596. "parameters": {
  121597. },
  121598. "attributes": {
  121599. "module_not_derived": "00000000000000000000000000000001",
  121600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121601. },
  121602. "port_directions": {
  121603. "C": "input",
  121604. "D": "input",
  121605. "E": "input",
  121606. "Q": "output"
  121607. },
  121608. "connections": {
  121609. "C": [ 42 ],
  121610. "D": [ 4078 ],
  121611. "E": [ 5089 ],
  121612. "Q": [ 2737 ]
  121613. }
  121614. },
  121615. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_18": {
  121616. "hide_name": 0,
  121617. "type": "SB_DFFE",
  121618. "parameters": {
  121619. },
  121620. "attributes": {
  121621. "module_not_derived": "00000000000000000000000000000001",
  121622. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121623. },
  121624. "port_directions": {
  121625. "C": "input",
  121626. "D": "input",
  121627. "E": "input",
  121628. "Q": "output"
  121629. },
  121630. "connections": {
  121631. "C": [ 42 ],
  121632. "D": [ 4083 ],
  121633. "E": [ 5089 ],
  121634. "Q": [ 2732 ]
  121635. }
  121636. },
  121637. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_19": {
  121638. "hide_name": 0,
  121639. "type": "SB_DFFE",
  121640. "parameters": {
  121641. },
  121642. "attributes": {
  121643. "module_not_derived": "00000000000000000000000000000001",
  121644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121645. },
  121646. "port_directions": {
  121647. "C": "input",
  121648. "D": "input",
  121649. "E": "input",
  121650. "Q": "output"
  121651. },
  121652. "connections": {
  121653. "C": [ 42 ],
  121654. "D": [ 4088 ],
  121655. "E": [ 5089 ],
  121656. "Q": [ 2727 ]
  121657. }
  121658. },
  121659. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_2": {
  121660. "hide_name": 0,
  121661. "type": "SB_DFFE",
  121662. "parameters": {
  121663. },
  121664. "attributes": {
  121665. "module_not_derived": "00000000000000000000000000000001",
  121666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121667. },
  121668. "port_directions": {
  121669. "C": "input",
  121670. "D": "input",
  121671. "E": "input",
  121672. "Q": "output"
  121673. },
  121674. "connections": {
  121675. "C": [ 42 ],
  121676. "D": [ 4000 ],
  121677. "E": [ 5089 ],
  121678. "Q": [ 2675 ]
  121679. }
  121680. },
  121681. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_20": {
  121682. "hide_name": 0,
  121683. "type": "SB_DFFE",
  121684. "parameters": {
  121685. },
  121686. "attributes": {
  121687. "module_not_derived": "00000000000000000000000000000001",
  121688. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121689. },
  121690. "port_directions": {
  121691. "C": "input",
  121692. "D": "input",
  121693. "E": "input",
  121694. "Q": "output"
  121695. },
  121696. "connections": {
  121697. "C": [ 42 ],
  121698. "D": [ 4093 ],
  121699. "E": [ 5089 ],
  121700. "Q": [ 2722 ]
  121701. }
  121702. },
  121703. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_21": {
  121704. "hide_name": 0,
  121705. "type": "SB_DFFE",
  121706. "parameters": {
  121707. },
  121708. "attributes": {
  121709. "module_not_derived": "00000000000000000000000000000001",
  121710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121711. },
  121712. "port_directions": {
  121713. "C": "input",
  121714. "D": "input",
  121715. "E": "input",
  121716. "Q": "output"
  121717. },
  121718. "connections": {
  121719. "C": [ 42 ],
  121720. "D": [ 4097 ],
  121721. "E": [ 5089 ],
  121722. "Q": [ 2712 ]
  121723. }
  121724. },
  121725. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_22": {
  121726. "hide_name": 0,
  121727. "type": "SB_DFFE",
  121728. "parameters": {
  121729. },
  121730. "attributes": {
  121731. "module_not_derived": "00000000000000000000000000000001",
  121732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121733. },
  121734. "port_directions": {
  121735. "C": "input",
  121736. "D": "input",
  121737. "E": "input",
  121738. "Q": "output"
  121739. },
  121740. "connections": {
  121741. "C": [ 42 ],
  121742. "D": [ 3998 ],
  121743. "E": [ 5089 ],
  121744. "Q": [ 2653 ]
  121745. }
  121746. },
  121747. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_23": {
  121748. "hide_name": 0,
  121749. "type": "SB_DFFE",
  121750. "parameters": {
  121751. },
  121752. "attributes": {
  121753. "module_not_derived": "00000000000000000000000000000001",
  121754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121755. },
  121756. "port_directions": {
  121757. "C": "input",
  121758. "D": "input",
  121759. "E": "input",
  121760. "Q": "output"
  121761. },
  121762. "connections": {
  121763. "C": [ 42 ],
  121764. "D": [ 4051 ],
  121765. "E": [ 5089 ],
  121766. "Q": [ 2718 ]
  121767. }
  121768. },
  121769. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_24": {
  121770. "hide_name": 0,
  121771. "type": "SB_DFFE",
  121772. "parameters": {
  121773. },
  121774. "attributes": {
  121775. "module_not_derived": "00000000000000000000000000000001",
  121776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121777. },
  121778. "port_directions": {
  121779. "C": "input",
  121780. "D": "input",
  121781. "E": "input",
  121782. "Q": "output"
  121783. },
  121784. "connections": {
  121785. "C": [ 42 ],
  121786. "D": [ 4103 ],
  121787. "E": [ 5089 ],
  121788. "Q": [ 2710 ]
  121789. }
  121790. },
  121791. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_25": {
  121792. "hide_name": 0,
  121793. "type": "SB_DFFE",
  121794. "parameters": {
  121795. },
  121796. "attributes": {
  121797. "module_not_derived": "00000000000000000000000000000001",
  121798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121799. },
  121800. "port_directions": {
  121801. "C": "input",
  121802. "D": "input",
  121803. "E": "input",
  121804. "Q": "output"
  121805. },
  121806. "connections": {
  121807. "C": [ 42 ],
  121808. "D": [ 4109 ],
  121809. "E": [ 5089 ],
  121810. "Q": [ 2705 ]
  121811. }
  121812. },
  121813. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_26": {
  121814. "hide_name": 0,
  121815. "type": "SB_DFFE",
  121816. "parameters": {
  121817. },
  121818. "attributes": {
  121819. "module_not_derived": "00000000000000000000000000000001",
  121820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121821. },
  121822. "port_directions": {
  121823. "C": "input",
  121824. "D": "input",
  121825. "E": "input",
  121826. "Q": "output"
  121827. },
  121828. "connections": {
  121829. "C": [ 42 ],
  121830. "D": [ 4114 ],
  121831. "E": [ 5089 ],
  121832. "Q": [ 2700 ]
  121833. }
  121834. },
  121835. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_27": {
  121836. "hide_name": 0,
  121837. "type": "SB_DFFE",
  121838. "parameters": {
  121839. },
  121840. "attributes": {
  121841. "module_not_derived": "00000000000000000000000000000001",
  121842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121843. },
  121844. "port_directions": {
  121845. "C": "input",
  121846. "D": "input",
  121847. "E": "input",
  121848. "Q": "output"
  121849. },
  121850. "connections": {
  121851. "C": [ 42 ],
  121852. "D": [ 4119 ],
  121853. "E": [ 5089 ],
  121854. "Q": [ 2695 ]
  121855. }
  121856. },
  121857. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_28": {
  121858. "hide_name": 0,
  121859. "type": "SB_DFFE",
  121860. "parameters": {
  121861. },
  121862. "attributes": {
  121863. "module_not_derived": "00000000000000000000000000000001",
  121864. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121865. },
  121866. "port_directions": {
  121867. "C": "input",
  121868. "D": "input",
  121869. "E": "input",
  121870. "Q": "output"
  121871. },
  121872. "connections": {
  121873. "C": [ 42 ],
  121874. "D": [ 4124 ],
  121875. "E": [ 5089 ],
  121876. "Q": [ 2690 ]
  121877. }
  121878. },
  121879. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_29": {
  121880. "hide_name": 0,
  121881. "type": "SB_DFFE",
  121882. "parameters": {
  121883. },
  121884. "attributes": {
  121885. "module_not_derived": "00000000000000000000000000000001",
  121886. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121887. },
  121888. "port_directions": {
  121889. "C": "input",
  121890. "D": "input",
  121891. "E": "input",
  121892. "Q": "output"
  121893. },
  121894. "connections": {
  121895. "C": [ 42 ],
  121896. "D": [ 4130 ],
  121897. "E": [ 5089 ],
  121898. "Q": [ 2685 ]
  121899. }
  121900. },
  121901. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_3": {
  121902. "hide_name": 0,
  121903. "type": "SB_DFFE",
  121904. "parameters": {
  121905. },
  121906. "attributes": {
  121907. "module_not_derived": "00000000000000000000000000000001",
  121908. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121909. },
  121910. "port_directions": {
  121911. "C": "input",
  121912. "D": "input",
  121913. "E": "input",
  121914. "Q": "output"
  121915. },
  121916. "connections": {
  121917. "C": [ 42 ],
  121918. "D": [ 4004 ],
  121919. "E": [ 5089 ],
  121920. "Q": [ 2663 ]
  121921. }
  121922. },
  121923. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_30": {
  121924. "hide_name": 0,
  121925. "type": "SB_DFFE",
  121926. "parameters": {
  121927. },
  121928. "attributes": {
  121929. "module_not_derived": "00000000000000000000000000000001",
  121930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121931. },
  121932. "port_directions": {
  121933. "C": "input",
  121934. "D": "input",
  121935. "E": "input",
  121936. "Q": "output"
  121937. },
  121938. "connections": {
  121939. "C": [ 42 ],
  121940. "D": [ 3996 ],
  121941. "E": [ 5089 ],
  121942. "Q": [ 2668 ]
  121943. }
  121944. },
  121945. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_31": {
  121946. "hide_name": 0,
  121947. "type": "SB_DFFE",
  121948. "parameters": {
  121949. },
  121950. "attributes": {
  121951. "module_not_derived": "00000000000000000000000000000001",
  121952. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121953. },
  121954. "port_directions": {
  121955. "C": "input",
  121956. "D": "input",
  121957. "E": "input",
  121958. "Q": "output"
  121959. },
  121960. "connections": {
  121961. "C": [ 42 ],
  121962. "D": [ 4105 ],
  121963. "E": [ 5089 ],
  121964. "Q": [ 2720 ]
  121965. }
  121966. },
  121967. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_4": {
  121968. "hide_name": 0,
  121969. "type": "SB_DFFE",
  121970. "parameters": {
  121971. },
  121972. "attributes": {
  121973. "module_not_derived": "00000000000000000000000000000001",
  121974. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121975. },
  121976. "port_directions": {
  121977. "C": "input",
  121978. "D": "input",
  121979. "E": "input",
  121980. "Q": "output"
  121981. },
  121982. "connections": {
  121983. "C": [ 42 ],
  121984. "D": [ 4008 ],
  121985. "E": [ 5089 ],
  121986. "Q": [ 2651 ]
  121987. }
  121988. },
  121989. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_5": {
  121990. "hide_name": 0,
  121991. "type": "SB_DFFE",
  121992. "parameters": {
  121993. },
  121994. "attributes": {
  121995. "module_not_derived": "00000000000000000000000000000001",
  121996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  121997. },
  121998. "port_directions": {
  121999. "C": "input",
  122000. "D": "input",
  122001. "E": "input",
  122002. "Q": "output"
  122003. },
  122004. "connections": {
  122005. "C": [ 42 ],
  122006. "D": [ 4013 ],
  122007. "E": [ 5089 ],
  122008. "Q": [ 2646 ]
  122009. }
  122010. },
  122011. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_6": {
  122012. "hide_name": 0,
  122013. "type": "SB_DFFE",
  122014. "parameters": {
  122015. },
  122016. "attributes": {
  122017. "module_not_derived": "00000000000000000000000000000001",
  122018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122019. },
  122020. "port_directions": {
  122021. "C": "input",
  122022. "D": "input",
  122023. "E": "input",
  122024. "Q": "output"
  122025. },
  122026. "connections": {
  122027. "C": [ 42 ],
  122028. "D": [ 4018 ],
  122029. "E": [ 5089 ],
  122030. "Q": [ 2641 ]
  122031. }
  122032. },
  122033. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_7": {
  122034. "hide_name": 0,
  122035. "type": "SB_DFFE",
  122036. "parameters": {
  122037. },
  122038. "attributes": {
  122039. "module_not_derived": "00000000000000000000000000000001",
  122040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122041. },
  122042. "port_directions": {
  122043. "C": "input",
  122044. "D": "input",
  122045. "E": "input",
  122046. "Q": "output"
  122047. },
  122048. "connections": {
  122049. "C": [ 42 ],
  122050. "D": [ 4023 ],
  122051. "E": [ 5089 ],
  122052. "Q": [ 2636 ]
  122053. }
  122054. },
  122055. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_8": {
  122056. "hide_name": 0,
  122057. "type": "SB_DFFE",
  122058. "parameters": {
  122059. },
  122060. "attributes": {
  122061. "module_not_derived": "00000000000000000000000000000001",
  122062. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122063. },
  122064. "port_directions": {
  122065. "C": "input",
  122066. "D": "input",
  122067. "E": "input",
  122068. "Q": "output"
  122069. },
  122070. "connections": {
  122071. "C": [ 42 ],
  122072. "D": [ 4027 ],
  122073. "E": [ 5089 ],
  122074. "Q": [ 2631 ]
  122075. }
  122076. },
  122077. "cpu_I.memory_DivPlugin_rs1_SB_DFFE_Q_9": {
  122078. "hide_name": 0,
  122079. "type": "SB_DFFE",
  122080. "parameters": {
  122081. },
  122082. "attributes": {
  122083. "module_not_derived": "00000000000000000000000000000001",
  122084. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122085. },
  122086. "port_directions": {
  122087. "C": "input",
  122088. "D": "input",
  122089. "E": "input",
  122090. "Q": "output"
  122091. },
  122092. "connections": {
  122093. "C": [ 42 ],
  122094. "D": [ 4032 ],
  122095. "E": [ 5089 ],
  122096. "Q": [ 2626 ]
  122097. }
  122098. },
  122099. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q": {
  122100. "hide_name": 0,
  122101. "type": "SB_DFFE",
  122102. "parameters": {
  122103. },
  122104. "attributes": {
  122105. "module_not_derived": "00000000000000000000000000000001",
  122106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122107. },
  122108. "port_directions": {
  122109. "C": "input",
  122110. "D": "input",
  122111. "E": "input",
  122112. "Q": "output"
  122113. },
  122114. "connections": {
  122115. "C": [ 42 ],
  122116. "D": [ 4138 ],
  122117. "E": [ 3995 ],
  122118. "Q": [ 5197 ]
  122119. }
  122120. },
  122121. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_1": {
  122122. "hide_name": 0,
  122123. "type": "SB_DFFE",
  122124. "parameters": {
  122125. },
  122126. "attributes": {
  122127. "module_not_derived": "00000000000000000000000000000001",
  122128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122129. },
  122130. "port_directions": {
  122131. "C": "input",
  122132. "D": "input",
  122133. "E": "input",
  122134. "Q": "output"
  122135. },
  122136. "connections": {
  122137. "C": [ 42 ],
  122138. "D": [ 4190 ],
  122139. "E": [ 3995 ],
  122140. "Q": [ 5194 ]
  122141. }
  122142. },
  122143. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_10": {
  122144. "hide_name": 0,
  122145. "type": "SB_DFFE",
  122146. "parameters": {
  122147. },
  122148. "attributes": {
  122149. "module_not_derived": "00000000000000000000000000000001",
  122150. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122151. },
  122152. "port_directions": {
  122153. "C": "input",
  122154. "D": "input",
  122155. "E": "input",
  122156. "Q": "output"
  122157. },
  122158. "connections": {
  122159. "C": [ 42 ],
  122160. "D": [ 4158 ],
  122161. "E": [ 3995 ],
  122162. "Q": [ 5162 ]
  122163. }
  122164. },
  122165. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_11": {
  122166. "hide_name": 0,
  122167. "type": "SB_DFFE",
  122168. "parameters": {
  122169. },
  122170. "attributes": {
  122171. "module_not_derived": "00000000000000000000000000000001",
  122172. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122173. },
  122174. "port_directions": {
  122175. "C": "input",
  122176. "D": "input",
  122177. "E": "input",
  122178. "Q": "output"
  122179. },
  122180. "connections": {
  122181. "C": [ 42 ],
  122182. "D": [ 4155 ],
  122183. "E": [ 3995 ],
  122184. "Q": [ 5159 ]
  122185. }
  122186. },
  122187. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_12": {
  122188. "hide_name": 0,
  122189. "type": "SB_DFFE",
  122190. "parameters": {
  122191. },
  122192. "attributes": {
  122193. "module_not_derived": "00000000000000000000000000000001",
  122194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122195. },
  122196. "port_directions": {
  122197. "C": "input",
  122198. "D": "input",
  122199. "E": "input",
  122200. "Q": "output"
  122201. },
  122202. "connections": {
  122203. "C": [ 42 ],
  122204. "D": [ 4149 ],
  122205. "E": [ 3995 ],
  122206. "Q": [ 5154 ]
  122207. }
  122208. },
  122209. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_13": {
  122210. "hide_name": 0,
  122211. "type": "SB_DFFE",
  122212. "parameters": {
  122213. },
  122214. "attributes": {
  122215. "module_not_derived": "00000000000000000000000000000001",
  122216. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122217. },
  122218. "port_directions": {
  122219. "C": "input",
  122220. "D": "input",
  122221. "E": "input",
  122222. "Q": "output"
  122223. },
  122224. "connections": {
  122225. "C": [ 42 ],
  122226. "D": [ 4230 ],
  122227. "E": [ 3995 ],
  122228. "Q": [ 5240 ]
  122229. }
  122230. },
  122231. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_14": {
  122232. "hide_name": 0,
  122233. "type": "SB_DFFE",
  122234. "parameters": {
  122235. },
  122236. "attributes": {
  122237. "module_not_derived": "00000000000000000000000000000001",
  122238. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122239. },
  122240. "port_directions": {
  122241. "C": "input",
  122242. "D": "input",
  122243. "E": "input",
  122244. "Q": "output"
  122245. },
  122246. "connections": {
  122247. "C": [ 42 ],
  122248. "D": [ 4229 ],
  122249. "E": [ 3995 ],
  122250. "Q": [ 5239 ]
  122251. }
  122252. },
  122253. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_15": {
  122254. "hide_name": 0,
  122255. "type": "SB_DFFE",
  122256. "parameters": {
  122257. },
  122258. "attributes": {
  122259. "module_not_derived": "00000000000000000000000000000001",
  122260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122261. },
  122262. "port_directions": {
  122263. "C": "input",
  122264. "D": "input",
  122265. "E": "input",
  122266. "Q": "output"
  122267. },
  122268. "connections": {
  122269. "C": [ 42 ],
  122270. "D": [ 4226 ],
  122271. "E": [ 3995 ],
  122272. "Q": [ 5236 ]
  122273. }
  122274. },
  122275. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_16": {
  122276. "hide_name": 0,
  122277. "type": "SB_DFFE",
  122278. "parameters": {
  122279. },
  122280. "attributes": {
  122281. "module_not_derived": "00000000000000000000000000000001",
  122282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122283. },
  122284. "port_directions": {
  122285. "C": "input",
  122286. "D": "input",
  122287. "E": "input",
  122288. "Q": "output"
  122289. },
  122290. "connections": {
  122291. "C": [ 42 ],
  122292. "D": [ 4223 ],
  122293. "E": [ 3995 ],
  122294. "Q": [ 5233 ]
  122295. }
  122296. },
  122297. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_17": {
  122298. "hide_name": 0,
  122299. "type": "SB_DFFE",
  122300. "parameters": {
  122301. },
  122302. "attributes": {
  122303. "module_not_derived": "00000000000000000000000000000001",
  122304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122305. },
  122306. "port_directions": {
  122307. "C": "input",
  122308. "D": "input",
  122309. "E": "input",
  122310. "Q": "output"
  122311. },
  122312. "connections": {
  122313. "C": [ 42 ],
  122314. "D": [ 4220 ],
  122315. "E": [ 3995 ],
  122316. "Q": [ 5230 ]
  122317. }
  122318. },
  122319. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_18": {
  122320. "hide_name": 0,
  122321. "type": "SB_DFFE",
  122322. "parameters": {
  122323. },
  122324. "attributes": {
  122325. "module_not_derived": "00000000000000000000000000000001",
  122326. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122327. },
  122328. "port_directions": {
  122329. "C": "input",
  122330. "D": "input",
  122331. "E": "input",
  122332. "Q": "output"
  122333. },
  122334. "connections": {
  122335. "C": [ 42 ],
  122336. "D": [ 4217 ],
  122337. "E": [ 3995 ],
  122338. "Q": [ 5227 ]
  122339. }
  122340. },
  122341. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_19": {
  122342. "hide_name": 0,
  122343. "type": "SB_DFFE",
  122344. "parameters": {
  122345. },
  122346. "attributes": {
  122347. "module_not_derived": "00000000000000000000000000000001",
  122348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122349. },
  122350. "port_directions": {
  122351. "C": "input",
  122352. "D": "input",
  122353. "E": "input",
  122354. "Q": "output"
  122355. },
  122356. "connections": {
  122357. "C": [ 42 ],
  122358. "D": [ 4214 ],
  122359. "E": [ 3995 ],
  122360. "Q": [ 5224 ]
  122361. }
  122362. },
  122363. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_2": {
  122364. "hide_name": 0,
  122365. "type": "SB_DFFE",
  122366. "parameters": {
  122367. },
  122368. "attributes": {
  122369. "module_not_derived": "00000000000000000000000000000001",
  122370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122371. },
  122372. "port_directions": {
  122373. "C": "input",
  122374. "D": "input",
  122375. "E": "input",
  122376. "Q": "output"
  122377. },
  122378. "connections": {
  122379. "C": [ 42 ],
  122380. "D": [ 4189 ],
  122381. "E": [ 3995 ],
  122382. "Q": [ 5191 ]
  122383. }
  122384. },
  122385. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_20": {
  122386. "hide_name": 0,
  122387. "type": "SB_DFFE",
  122388. "parameters": {
  122389. },
  122390. "attributes": {
  122391. "module_not_derived": "00000000000000000000000000000001",
  122392. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122393. },
  122394. "port_directions": {
  122395. "C": "input",
  122396. "D": "input",
  122397. "E": "input",
  122398. "Q": "output"
  122399. },
  122400. "connections": {
  122401. "C": [ 42 ],
  122402. "D": [ 4182 ],
  122403. "E": [ 3995 ],
  122404. "Q": [ 5215 ]
  122405. }
  122406. },
  122407. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_21": {
  122408. "hide_name": 0,
  122409. "type": "SB_DFFE",
  122410. "parameters": {
  122411. },
  122412. "attributes": {
  122413. "module_not_derived": "00000000000000000000000000000001",
  122414. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122415. },
  122416. "port_directions": {
  122417. "C": "input",
  122418. "D": "input",
  122419. "E": "input",
  122420. "Q": "output"
  122421. },
  122422. "connections": {
  122423. "C": [ 42 ],
  122424. "D": [ 4146 ],
  122425. "E": [ 3995 ],
  122426. "Q": [ 5180 ]
  122427. }
  122428. },
  122429. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_22": {
  122430. "hide_name": 0,
  122431. "type": "SB_DFFE",
  122432. "parameters": {
  122433. },
  122434. "attributes": {
  122435. "module_not_derived": "00000000000000000000000000000001",
  122436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122437. },
  122438. "port_directions": {
  122439. "C": "input",
  122440. "D": "input",
  122441. "E": "input",
  122442. "Q": "output"
  122443. },
  122444. "connections": {
  122445. "C": [ 42 ],
  122446. "D": [ 4143 ],
  122447. "E": [ 3995 ],
  122448. "Q": [ 5241 ]
  122449. }
  122450. },
  122451. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_23": {
  122452. "hide_name": 0,
  122453. "type": "SB_DFFE",
  122454. "parameters": {
  122455. },
  122456. "attributes": {
  122457. "module_not_derived": "00000000000000000000000000000001",
  122458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122459. },
  122460. "port_directions": {
  122461. "C": "input",
  122462. "D": "input",
  122463. "E": "input",
  122464. "Q": "output"
  122465. },
  122466. "connections": {
  122467. "C": [ 42 ],
  122468. "D": [ 4211 ],
  122469. "E": [ 3995 ],
  122470. "Q": [ 5223 ]
  122471. }
  122472. },
  122473. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_24": {
  122474. "hide_name": 0,
  122475. "type": "SB_DFFE",
  122476. "parameters": {
  122477. },
  122478. "attributes": {
  122479. "module_not_derived": "00000000000000000000000000000001",
  122480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122481. },
  122482. "port_directions": {
  122483. "C": "input",
  122484. "D": "input",
  122485. "E": "input",
  122486. "Q": "output"
  122487. },
  122488. "connections": {
  122489. "C": [ 42 ],
  122490. "D": [ 4208 ],
  122491. "E": [ 3995 ],
  122492. "Q": [ 5220 ]
  122493. }
  122494. },
  122495. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_25": {
  122496. "hide_name": 0,
  122497. "type": "SB_DFFE",
  122498. "parameters": {
  122499. },
  122500. "attributes": {
  122501. "module_not_derived": "00000000000000000000000000000001",
  122502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122503. },
  122504. "port_directions": {
  122505. "C": "input",
  122506. "D": "input",
  122507. "E": "input",
  122508. "Q": "output"
  122509. },
  122510. "connections": {
  122511. "C": [ 42 ],
  122512. "D": [ 4205 ],
  122513. "E": [ 3995 ],
  122514. "Q": [ 5214 ]
  122515. }
  122516. },
  122517. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_26": {
  122518. "hide_name": 0,
  122519. "type": "SB_DFFE",
  122520. "parameters": {
  122521. },
  122522. "attributes": {
  122523. "module_not_derived": "00000000000000000000000000000001",
  122524. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122525. },
  122526. "port_directions": {
  122527. "C": "input",
  122528. "D": "input",
  122529. "E": "input",
  122530. "Q": "output"
  122531. },
  122532. "connections": {
  122533. "C": [ 42 ],
  122534. "D": [ 4202 ],
  122535. "E": [ 3995 ],
  122536. "Q": [ 5211 ]
  122537. }
  122538. },
  122539. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_27": {
  122540. "hide_name": 0,
  122541. "type": "SB_DFFE",
  122542. "parameters": {
  122543. },
  122544. "attributes": {
  122545. "module_not_derived": "00000000000000000000000000000001",
  122546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122547. },
  122548. "port_directions": {
  122549. "C": "input",
  122550. "D": "input",
  122551. "E": "input",
  122552. "Q": "output"
  122553. },
  122554. "connections": {
  122555. "C": [ 42 ],
  122556. "D": [ 4199 ],
  122557. "E": [ 3995 ],
  122558. "Q": [ 5208 ]
  122559. }
  122560. },
  122561. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_28": {
  122562. "hide_name": 0,
  122563. "type": "SB_DFFE",
  122564. "parameters": {
  122565. },
  122566. "attributes": {
  122567. "module_not_derived": "00000000000000000000000000000001",
  122568. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122569. },
  122570. "port_directions": {
  122571. "C": "input",
  122572. "D": "input",
  122573. "E": "input",
  122574. "Q": "output"
  122575. },
  122576. "connections": {
  122577. "C": [ 42 ],
  122578. "D": [ 4196 ],
  122579. "E": [ 3995 ],
  122580. "Q": [ 5205 ]
  122581. }
  122582. },
  122583. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_29": {
  122584. "hide_name": 0,
  122585. "type": "SB_DFFE",
  122586. "parameters": {
  122587. },
  122588. "attributes": {
  122589. "module_not_derived": "00000000000000000000000000000001",
  122590. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122591. },
  122592. "port_directions": {
  122593. "C": "input",
  122594. "D": "input",
  122595. "E": "input",
  122596. "Q": "output"
  122597. },
  122598. "connections": {
  122599. "C": [ 42 ],
  122600. "D": [ 4193 ],
  122601. "E": [ 3995 ],
  122602. "Q": [ 5202 ]
  122603. }
  122604. },
  122605. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_3": {
  122606. "hide_name": 0,
  122607. "type": "SB_DFFE",
  122608. "parameters": {
  122609. },
  122610. "attributes": {
  122611. "module_not_derived": "00000000000000000000000000000001",
  122612. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122613. },
  122614. "port_directions": {
  122615. "C": "input",
  122616. "D": "input",
  122617. "E": "input",
  122618. "Q": "output"
  122619. },
  122620. "connections": {
  122621. "C": [ 42 ],
  122622. "D": [ 4179 ],
  122623. "E": [ 3995 ],
  122624. "Q": [ 5185 ]
  122625. }
  122626. },
  122627. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_30": {
  122628. "hide_name": 0,
  122629. "type": "SB_DFFE",
  122630. "parameters": {
  122631. },
  122632. "attributes": {
  122633. "module_not_derived": "00000000000000000000000000000001",
  122634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122635. },
  122636. "port_directions": {
  122637. "C": "input",
  122638. "D": "input",
  122639. "E": "input",
  122640. "Q": "output"
  122641. },
  122642. "connections": {
  122643. "C": [ 42 ],
  122644. "D": [ 4185 ],
  122645. "E": [ 3995 ],
  122646. "Q": [ 5188 ]
  122647. }
  122648. },
  122649. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_31": {
  122650. "hide_name": 0,
  122651. "type": "SB_DFFE",
  122652. "parameters": {
  122653. },
  122654. "attributes": {
  122655. "module_not_derived": "00000000000000000000000000000001",
  122656. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122657. },
  122658. "port_directions": {
  122659. "C": "input",
  122660. "D": "input",
  122661. "E": "input",
  122662. "Q": "output"
  122663. },
  122664. "connections": {
  122665. "C": [ 42 ],
  122666. "D": [ 3639 ],
  122667. "E": [ 3995 ],
  122668. "Q": [ 5151 ]
  122669. }
  122670. },
  122671. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_4": {
  122672. "hide_name": 0,
  122673. "type": "SB_DFFE",
  122674. "parameters": {
  122675. },
  122676. "attributes": {
  122677. "module_not_derived": "00000000000000000000000000000001",
  122678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122679. },
  122680. "port_directions": {
  122681. "C": "input",
  122682. "D": "input",
  122683. "E": "input",
  122684. "Q": "output"
  122685. },
  122686. "connections": {
  122687. "C": [ 42 ],
  122688. "D": [ 4176 ],
  122689. "E": [ 3995 ],
  122690. "Q": [ 5179 ]
  122691. }
  122692. },
  122693. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_5": {
  122694. "hide_name": 0,
  122695. "type": "SB_DFFE",
  122696. "parameters": {
  122697. },
  122698. "attributes": {
  122699. "module_not_derived": "00000000000000000000000000000001",
  122700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122701. },
  122702. "port_directions": {
  122703. "C": "input",
  122704. "D": "input",
  122705. "E": "input",
  122706. "Q": "output"
  122707. },
  122708. "connections": {
  122709. "C": [ 42 ],
  122710. "D": [ 4173 ],
  122711. "E": [ 3995 ],
  122712. "Q": [ 5176 ]
  122713. }
  122714. },
  122715. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_6": {
  122716. "hide_name": 0,
  122717. "type": "SB_DFFE",
  122718. "parameters": {
  122719. },
  122720. "attributes": {
  122721. "module_not_derived": "00000000000000000000000000000001",
  122722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122723. },
  122724. "port_directions": {
  122725. "C": "input",
  122726. "D": "input",
  122727. "E": "input",
  122728. "Q": "output"
  122729. },
  122730. "connections": {
  122731. "C": [ 42 ],
  122732. "D": [ 4170 ],
  122733. "E": [ 3995 ],
  122734. "Q": [ 5173 ]
  122735. }
  122736. },
  122737. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_7": {
  122738. "hide_name": 0,
  122739. "type": "SB_DFFE",
  122740. "parameters": {
  122741. },
  122742. "attributes": {
  122743. "module_not_derived": "00000000000000000000000000000001",
  122744. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122745. },
  122746. "port_directions": {
  122747. "C": "input",
  122748. "D": "input",
  122749. "E": "input",
  122750. "Q": "output"
  122751. },
  122752. "connections": {
  122753. "C": [ 42 ],
  122754. "D": [ 4167 ],
  122755. "E": [ 3995 ],
  122756. "Q": [ 5170 ]
  122757. }
  122758. },
  122759. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_8": {
  122760. "hide_name": 0,
  122761. "type": "SB_DFFE",
  122762. "parameters": {
  122763. },
  122764. "attributes": {
  122765. "module_not_derived": "00000000000000000000000000000001",
  122766. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122767. },
  122768. "port_directions": {
  122769. "C": "input",
  122770. "D": "input",
  122771. "E": "input",
  122772. "Q": "output"
  122773. },
  122774. "connections": {
  122775. "C": [ 42 ],
  122776. "D": [ 4164 ],
  122777. "E": [ 3995 ],
  122778. "Q": [ 5167 ]
  122779. }
  122780. },
  122781. "cpu_I.memory_DivPlugin_rs2_SB_DFFE_Q_9": {
  122782. "hide_name": 0,
  122783. "type": "SB_DFFE",
  122784. "parameters": {
  122785. },
  122786. "attributes": {
  122787. "module_not_derived": "00000000000000000000000000000001",
  122788. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  122789. },
  122790. "port_directions": {
  122791. "C": "input",
  122792. "D": "input",
  122793. "E": "input",
  122794. "Q": "output"
  122795. },
  122796. "connections": {
  122797. "C": [ 42 ],
  122798. "D": [ 4161 ],
  122799. "E": [ 3995 ],
  122800. "Q": [ 5199 ]
  122801. }
  122802. },
  122803. "cpu_I.memory_MUL_LOW_SB_LUT4_O": {
  122804. "hide_name": 0,
  122805. "type": "SB_LUT4",
  122806. "parameters": {
  122807. "LUT_INIT": "0110100110010110"
  122808. },
  122809. "attributes": {
  122810. "module_not_derived": "00000000000000000000000000000001",
  122811. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  122812. },
  122813. "port_directions": {
  122814. "I0": "input",
  122815. "I1": "input",
  122816. "I2": "input",
  122817. "I3": "input",
  122818. "O": "output"
  122819. },
  122820. "connections": {
  122821. "I0": [ "0" ],
  122822. "I1": [ 5242 ],
  122823. "I2": [ 5243 ],
  122824. "I3": [ 5244 ],
  122825. "O": [ 5245 ]
  122826. }
  122827. },
  122828. "cpu_I.memory_MUL_LOW_SB_LUT4_O_1": {
  122829. "hide_name": 0,
  122830. "type": "SB_LUT4",
  122831. "parameters": {
  122832. "LUT_INIT": "1001001101101100"
  122833. },
  122834. "attributes": {
  122835. "module_not_derived": "00000000000000000000000000000001",
  122836. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  122837. },
  122838. "port_directions": {
  122839. "I0": "input",
  122840. "I1": "input",
  122841. "I2": "input",
  122842. "I3": "input",
  122843. "O": "output"
  122844. },
  122845. "connections": {
  122846. "I0": [ 4987 ],
  122847. "I1": [ 5246 ],
  122848. "I2": [ 4950 ],
  122849. "I3": [ 5247 ],
  122850. "O": [ 5248 ]
  122851. }
  122852. },
  122853. "cpu_I.memory_MUL_LOW_SB_LUT4_O_10": {
  122854. "hide_name": 0,
  122855. "type": "SB_LUT4",
  122856. "parameters": {
  122857. "LUT_INIT": "0110100110010110"
  122858. },
  122859. "attributes": {
  122860. "module_not_derived": "00000000000000000000000000000001",
  122861. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  122862. },
  122863. "port_directions": {
  122864. "I0": "input",
  122865. "I1": "input",
  122866. "I2": "input",
  122867. "I3": "input",
  122868. "O": "output"
  122869. },
  122870. "connections": {
  122871. "I0": [ "0" ],
  122872. "I1": [ 5249 ],
  122873. "I2": [ 5250 ],
  122874. "I3": [ 5251 ],
  122875. "O": [ 5252 ]
  122876. }
  122877. },
  122878. "cpu_I.memory_MUL_LOW_SB_LUT4_O_10_I1_SB_LUT4_O": {
  122879. "hide_name": 0,
  122880. "type": "SB_LUT4",
  122881. "parameters": {
  122882. "LUT_INIT": "1111110011000000"
  122883. },
  122884. "attributes": {
  122885. "module_not_derived": "00000000000000000000000000000001",
  122886. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  122887. },
  122888. "port_directions": {
  122889. "I0": "input",
  122890. "I1": "input",
  122891. "I2": "input",
  122892. "I3": "input",
  122893. "O": "output"
  122894. },
  122895. "connections": {
  122896. "I0": [ "0" ],
  122897. "I1": [ 5049 ],
  122898. "I2": [ 5014 ],
  122899. "I3": [ 4978 ],
  122900. "O": [ 5250 ]
  122901. }
  122902. },
  122903. "cpu_I.memory_MUL_LOW_SB_LUT4_O_10_I1_SB_LUT4_O_1": {
  122904. "hide_name": 0,
  122905. "type": "SB_LUT4",
  122906. "parameters": {
  122907. "LUT_INIT": "1100001100111100"
  122908. },
  122909. "attributes": {
  122910. "module_not_derived": "00000000000000000000000000000001",
  122911. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  122912. },
  122913. "port_directions": {
  122914. "I0": "input",
  122915. "I1": "input",
  122916. "I2": "input",
  122917. "I3": "input",
  122918. "O": "output"
  122919. },
  122920. "connections": {
  122921. "I0": [ "0" ],
  122922. "I1": [ 5050 ],
  122923. "I2": [ 4979 ],
  122924. "I3": [ 5015 ],
  122925. "O": [ 5249 ]
  122926. }
  122927. },
  122928. "cpu_I.memory_MUL_LOW_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  122929. "hide_name": 0,
  122930. "type": "SB_CARRY",
  122931. "parameters": {
  122932. },
  122933. "attributes": {
  122934. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  122935. },
  122936. "port_directions": {
  122937. "CI": "input",
  122938. "CO": "output",
  122939. "I0": "input",
  122940. "I1": "input"
  122941. },
  122942. "connections": {
  122943. "CI": [ 5253 ],
  122944. "CO": [ 5251 ],
  122945. "I0": [ 5254 ],
  122946. "I1": [ 5255 ]
  122947. }
  122948. },
  122949. "cpu_I.memory_MUL_LOW_SB_LUT4_O_11": {
  122950. "hide_name": 0,
  122951. "type": "SB_LUT4",
  122952. "parameters": {
  122953. "LUT_INIT": "0110100110010110"
  122954. },
  122955. "attributes": {
  122956. "module_not_derived": "00000000000000000000000000000001",
  122957. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  122958. },
  122959. "port_directions": {
  122960. "I0": "input",
  122961. "I1": "input",
  122962. "I2": "input",
  122963. "I3": "input",
  122964. "O": "output"
  122965. },
  122966. "connections": {
  122967. "I0": [ "0" ],
  122968. "I1": [ 5256 ],
  122969. "I2": [ 5257 ],
  122970. "I3": [ 5258 ],
  122971. "O": [ 5259 ]
  122972. }
  122973. },
  122974. "cpu_I.memory_MUL_LOW_SB_LUT4_O_11_I1_SB_LUT4_O": {
  122975. "hide_name": 0,
  122976. "type": "SB_LUT4",
  122977. "parameters": {
  122978. "LUT_INIT": "1111110011000000"
  122979. },
  122980. "attributes": {
  122981. "module_not_derived": "00000000000000000000000000000001",
  122982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  122983. },
  122984. "port_directions": {
  122985. "I0": "input",
  122986. "I1": "input",
  122987. "I2": "input",
  122988. "I3": "input",
  122989. "O": "output"
  122990. },
  122991. "connections": {
  122992. "I0": [ "0" ],
  122993. "I1": [ 5050 ],
  122994. "I2": [ 4979 ],
  122995. "I3": [ 5015 ],
  122996. "O": [ 5257 ]
  122997. }
  122998. },
  122999. "cpu_I.memory_MUL_LOW_SB_LUT4_O_11_I1_SB_LUT4_O_1": {
  123000. "hide_name": 0,
  123001. "type": "SB_LUT4",
  123002. "parameters": {
  123003. "LUT_INIT": "1100001100111100"
  123004. },
  123005. "attributes": {
  123006. "module_not_derived": "00000000000000000000000000000001",
  123007. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123008. },
  123009. "port_directions": {
  123010. "I0": "input",
  123011. "I1": "input",
  123012. "I2": "input",
  123013. "I3": "input",
  123014. "O": "output"
  123015. },
  123016. "connections": {
  123017. "I0": [ "0" ],
  123018. "I1": [ 5051 ],
  123019. "I2": [ 4980 ],
  123020. "I3": [ 5016 ],
  123021. "O": [ 5256 ]
  123022. }
  123023. },
  123024. "cpu_I.memory_MUL_LOW_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  123025. "hide_name": 0,
  123026. "type": "SB_CARRY",
  123027. "parameters": {
  123028. },
  123029. "attributes": {
  123030. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123031. },
  123032. "port_directions": {
  123033. "CI": "input",
  123034. "CO": "output",
  123035. "I0": "input",
  123036. "I1": "input"
  123037. },
  123038. "connections": {
  123039. "CI": [ 5251 ],
  123040. "CO": [ 5258 ],
  123041. "I0": [ 5249 ],
  123042. "I1": [ 5250 ]
  123043. }
  123044. },
  123045. "cpu_I.memory_MUL_LOW_SB_LUT4_O_12": {
  123046. "hide_name": 0,
  123047. "type": "SB_LUT4",
  123048. "parameters": {
  123049. "LUT_INIT": "0110100110010110"
  123050. },
  123051. "attributes": {
  123052. "module_not_derived": "00000000000000000000000000000001",
  123053. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123054. },
  123055. "port_directions": {
  123056. "I0": "input",
  123057. "I1": "input",
  123058. "I2": "input",
  123059. "I3": "input",
  123060. "O": "output"
  123061. },
  123062. "connections": {
  123063. "I0": [ "0" ],
  123064. "I1": [ 5260 ],
  123065. "I2": [ 5261 ],
  123066. "I3": [ 5262 ],
  123067. "O": [ 5263 ]
  123068. }
  123069. },
  123070. "cpu_I.memory_MUL_LOW_SB_LUT4_O_12_I1_SB_LUT4_O": {
  123071. "hide_name": 0,
  123072. "type": "SB_LUT4",
  123073. "parameters": {
  123074. "LUT_INIT": "1111110011000000"
  123075. },
  123076. "attributes": {
  123077. "module_not_derived": "00000000000000000000000000000001",
  123078. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123079. },
  123080. "port_directions": {
  123081. "I0": "input",
  123082. "I1": "input",
  123083. "I2": "input",
  123084. "I3": "input",
  123085. "O": "output"
  123086. },
  123087. "connections": {
  123088. "I0": [ "0" ],
  123089. "I1": [ 5051 ],
  123090. "I2": [ 4980 ],
  123091. "I3": [ 5016 ],
  123092. "O": [ 5261 ]
  123093. }
  123094. },
  123095. "cpu_I.memory_MUL_LOW_SB_LUT4_O_12_I1_SB_LUT4_O_1": {
  123096. "hide_name": 0,
  123097. "type": "SB_LUT4",
  123098. "parameters": {
  123099. "LUT_INIT": "1100001100111100"
  123100. },
  123101. "attributes": {
  123102. "module_not_derived": "00000000000000000000000000000001",
  123103. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123104. },
  123105. "port_directions": {
  123106. "I0": "input",
  123107. "I1": "input",
  123108. "I2": "input",
  123109. "I3": "input",
  123110. "O": "output"
  123111. },
  123112. "connections": {
  123113. "I0": [ "0" ],
  123114. "I1": [ 5052 ],
  123115. "I2": [ 5017 ],
  123116. "I3": [ 4981 ],
  123117. "O": [ 5260 ]
  123118. }
  123119. },
  123120. "cpu_I.memory_MUL_LOW_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  123121. "hide_name": 0,
  123122. "type": "SB_CARRY",
  123123. "parameters": {
  123124. },
  123125. "attributes": {
  123126. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123127. },
  123128. "port_directions": {
  123129. "CI": "input",
  123130. "CO": "output",
  123131. "I0": "input",
  123132. "I1": "input"
  123133. },
  123134. "connections": {
  123135. "CI": [ 5258 ],
  123136. "CO": [ 5262 ],
  123137. "I0": [ 5256 ],
  123138. "I1": [ 5257 ]
  123139. }
  123140. },
  123141. "cpu_I.memory_MUL_LOW_SB_LUT4_O_13": {
  123142. "hide_name": 0,
  123143. "type": "SB_LUT4",
  123144. "parameters": {
  123145. "LUT_INIT": "0110100110010110"
  123146. },
  123147. "attributes": {
  123148. "module_not_derived": "00000000000000000000000000000001",
  123149. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123150. },
  123151. "port_directions": {
  123152. "I0": "input",
  123153. "I1": "input",
  123154. "I2": "input",
  123155. "I3": "input",
  123156. "O": "output"
  123157. },
  123158. "connections": {
  123159. "I0": [ "0" ],
  123160. "I1": [ 5264 ],
  123161. "I2": [ 5265 ],
  123162. "I3": [ 5266 ],
  123163. "O": [ 5267 ]
  123164. }
  123165. },
  123166. "cpu_I.memory_MUL_LOW_SB_LUT4_O_13_I1_SB_LUT4_O": {
  123167. "hide_name": 0,
  123168. "type": "SB_LUT4",
  123169. "parameters": {
  123170. "LUT_INIT": "1111110011000000"
  123171. },
  123172. "attributes": {
  123173. "module_not_derived": "00000000000000000000000000000001",
  123174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123175. },
  123176. "port_directions": {
  123177. "I0": "input",
  123178. "I1": "input",
  123179. "I2": "input",
  123180. "I3": "input",
  123181. "O": "output"
  123182. },
  123183. "connections": {
  123184. "I0": [ "0" ],
  123185. "I1": [ 5052 ],
  123186. "I2": [ 5017 ],
  123187. "I3": [ 4981 ],
  123188. "O": [ 5265 ]
  123189. }
  123190. },
  123191. "cpu_I.memory_MUL_LOW_SB_LUT4_O_13_I1_SB_LUT4_O_1": {
  123192. "hide_name": 0,
  123193. "type": "SB_LUT4",
  123194. "parameters": {
  123195. "LUT_INIT": "1100001100111100"
  123196. },
  123197. "attributes": {
  123198. "module_not_derived": "00000000000000000000000000000001",
  123199. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123200. },
  123201. "port_directions": {
  123202. "I0": "input",
  123203. "I1": "input",
  123204. "I2": "input",
  123205. "I3": "input",
  123206. "O": "output"
  123207. },
  123208. "connections": {
  123209. "I0": [ "0" ],
  123210. "I1": [ 5053 ],
  123211. "I2": [ 5018 ],
  123212. "I3": [ 4982 ],
  123213. "O": [ 5264 ]
  123214. }
  123215. },
  123216. "cpu_I.memory_MUL_LOW_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  123217. "hide_name": 0,
  123218. "type": "SB_CARRY",
  123219. "parameters": {
  123220. },
  123221. "attributes": {
  123222. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123223. },
  123224. "port_directions": {
  123225. "CI": "input",
  123226. "CO": "output",
  123227. "I0": "input",
  123228. "I1": "input"
  123229. },
  123230. "connections": {
  123231. "CI": [ 5262 ],
  123232. "CO": [ 5266 ],
  123233. "I0": [ 5260 ],
  123234. "I1": [ 5261 ]
  123235. }
  123236. },
  123237. "cpu_I.memory_MUL_LOW_SB_LUT4_O_14": {
  123238. "hide_name": 0,
  123239. "type": "SB_LUT4",
  123240. "parameters": {
  123241. "LUT_INIT": "0110100110010110"
  123242. },
  123243. "attributes": {
  123244. "module_not_derived": "00000000000000000000000000000001",
  123245. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123246. },
  123247. "port_directions": {
  123248. "I0": "input",
  123249. "I1": "input",
  123250. "I2": "input",
  123251. "I3": "input",
  123252. "O": "output"
  123253. },
  123254. "connections": {
  123255. "I0": [ "0" ],
  123256. "I1": [ 5268 ],
  123257. "I2": [ 5269 ],
  123258. "I3": [ 5270 ],
  123259. "O": [ 5271 ]
  123260. }
  123261. },
  123262. "cpu_I.memory_MUL_LOW_SB_LUT4_O_14_I1_SB_LUT4_O": {
  123263. "hide_name": 0,
  123264. "type": "SB_LUT4",
  123265. "parameters": {
  123266. "LUT_INIT": "1111110011000000"
  123267. },
  123268. "attributes": {
  123269. "module_not_derived": "00000000000000000000000000000001",
  123270. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123271. },
  123272. "port_directions": {
  123273. "I0": "input",
  123274. "I1": "input",
  123275. "I2": "input",
  123276. "I3": "input",
  123277. "O": "output"
  123278. },
  123279. "connections": {
  123280. "I0": [ "0" ],
  123281. "I1": [ 5053 ],
  123282. "I2": [ 5018 ],
  123283. "I3": [ 4982 ],
  123284. "O": [ 5269 ]
  123285. }
  123286. },
  123287. "cpu_I.memory_MUL_LOW_SB_LUT4_O_14_I1_SB_LUT4_O_1": {
  123288. "hide_name": 0,
  123289. "type": "SB_LUT4",
  123290. "parameters": {
  123291. "LUT_INIT": "1100001100111100"
  123292. },
  123293. "attributes": {
  123294. "module_not_derived": "00000000000000000000000000000001",
  123295. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123296. },
  123297. "port_directions": {
  123298. "I0": "input",
  123299. "I1": "input",
  123300. "I2": "input",
  123301. "I3": "input",
  123302. "O": "output"
  123303. },
  123304. "connections": {
  123305. "I0": [ "0" ],
  123306. "I1": [ 5054 ],
  123307. "I2": [ 5019 ],
  123308. "I3": [ 4983 ],
  123309. "O": [ 5268 ]
  123310. }
  123311. },
  123312. "cpu_I.memory_MUL_LOW_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  123313. "hide_name": 0,
  123314. "type": "SB_CARRY",
  123315. "parameters": {
  123316. },
  123317. "attributes": {
  123318. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123319. },
  123320. "port_directions": {
  123321. "CI": "input",
  123322. "CO": "output",
  123323. "I0": "input",
  123324. "I1": "input"
  123325. },
  123326. "connections": {
  123327. "CI": [ 5266 ],
  123328. "CO": [ 5270 ],
  123329. "I0": [ 5264 ],
  123330. "I1": [ 5265 ]
  123331. }
  123332. },
  123333. "cpu_I.memory_MUL_LOW_SB_LUT4_O_15": {
  123334. "hide_name": 0,
  123335. "type": "SB_LUT4",
  123336. "parameters": {
  123337. "LUT_INIT": "0110100110010110"
  123338. },
  123339. "attributes": {
  123340. "module_not_derived": "00000000000000000000000000000001",
  123341. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123342. },
  123343. "port_directions": {
  123344. "I0": "input",
  123345. "I1": "input",
  123346. "I2": "input",
  123347. "I3": "input",
  123348. "O": "output"
  123349. },
  123350. "connections": {
  123351. "I0": [ "0" ],
  123352. "I1": [ 5272 ],
  123353. "I2": [ 5273 ],
  123354. "I3": [ 5274 ],
  123355. "O": [ 5275 ]
  123356. }
  123357. },
  123358. "cpu_I.memory_MUL_LOW_SB_LUT4_O_15_I1_SB_LUT4_O": {
  123359. "hide_name": 0,
  123360. "type": "SB_LUT4",
  123361. "parameters": {
  123362. "LUT_INIT": "1111110011000000"
  123363. },
  123364. "attributes": {
  123365. "module_not_derived": "00000000000000000000000000000001",
  123366. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123367. },
  123368. "port_directions": {
  123369. "I0": "input",
  123370. "I1": "input",
  123371. "I2": "input",
  123372. "I3": "input",
  123373. "O": "output"
  123374. },
  123375. "connections": {
  123376. "I0": [ "0" ],
  123377. "I1": [ 5054 ],
  123378. "I2": [ 5019 ],
  123379. "I3": [ 4983 ],
  123380. "O": [ 5273 ]
  123381. }
  123382. },
  123383. "cpu_I.memory_MUL_LOW_SB_LUT4_O_15_I1_SB_LUT4_O_1": {
  123384. "hide_name": 0,
  123385. "type": "SB_LUT4",
  123386. "parameters": {
  123387. "LUT_INIT": "1100001100111100"
  123388. },
  123389. "attributes": {
  123390. "module_not_derived": "00000000000000000000000000000001",
  123391. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123392. },
  123393. "port_directions": {
  123394. "I0": "input",
  123395. "I1": "input",
  123396. "I2": "input",
  123397. "I3": "input",
  123398. "O": "output"
  123399. },
  123400. "connections": {
  123401. "I0": [ "0" ],
  123402. "I1": [ 5055 ],
  123403. "I2": [ 5020 ],
  123404. "I3": [ 4984 ],
  123405. "O": [ 5272 ]
  123406. }
  123407. },
  123408. "cpu_I.memory_MUL_LOW_SB_LUT4_O_15_I3_SB_CARRY_CO": {
  123409. "hide_name": 0,
  123410. "type": "SB_CARRY",
  123411. "parameters": {
  123412. },
  123413. "attributes": {
  123414. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123415. },
  123416. "port_directions": {
  123417. "CI": "input",
  123418. "CO": "output",
  123419. "I0": "input",
  123420. "I1": "input"
  123421. },
  123422. "connections": {
  123423. "CI": [ 5270 ],
  123424. "CO": [ 5274 ],
  123425. "I0": [ 5268 ],
  123426. "I1": [ 5269 ]
  123427. }
  123428. },
  123429. "cpu_I.memory_MUL_LOW_SB_LUT4_O_16": {
  123430. "hide_name": 0,
  123431. "type": "SB_LUT4",
  123432. "parameters": {
  123433. "LUT_INIT": "0110100110010110"
  123434. },
  123435. "attributes": {
  123436. "module_not_derived": "00000000000000000000000000000001",
  123437. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123438. },
  123439. "port_directions": {
  123440. "I0": "input",
  123441. "I1": "input",
  123442. "I2": "input",
  123443. "I3": "input",
  123444. "O": "output"
  123445. },
  123446. "connections": {
  123447. "I0": [ "0" ],
  123448. "I1": [ 5276 ],
  123449. "I2": [ 5277 ],
  123450. "I3": [ 5278 ],
  123451. "O": [ 5279 ]
  123452. }
  123453. },
  123454. "cpu_I.memory_MUL_LOW_SB_LUT4_O_16_I1_SB_LUT4_O": {
  123455. "hide_name": 0,
  123456. "type": "SB_LUT4",
  123457. "parameters": {
  123458. "LUT_INIT": "1111110011000000"
  123459. },
  123460. "attributes": {
  123461. "module_not_derived": "00000000000000000000000000000001",
  123462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123463. },
  123464. "port_directions": {
  123465. "I0": "input",
  123466. "I1": "input",
  123467. "I2": "input",
  123468. "I3": "input",
  123469. "O": "output"
  123470. },
  123471. "connections": {
  123472. "I0": [ "0" ],
  123473. "I1": [ 5055 ],
  123474. "I2": [ 5020 ],
  123475. "I3": [ 4984 ],
  123476. "O": [ 5277 ]
  123477. }
  123478. },
  123479. "cpu_I.memory_MUL_LOW_SB_LUT4_O_16_I1_SB_LUT4_O_1": {
  123480. "hide_name": 0,
  123481. "type": "SB_LUT4",
  123482. "parameters": {
  123483. "LUT_INIT": "1100001100111100"
  123484. },
  123485. "attributes": {
  123486. "module_not_derived": "00000000000000000000000000000001",
  123487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123488. },
  123489. "port_directions": {
  123490. "I0": "input",
  123491. "I1": "input",
  123492. "I2": "input",
  123493. "I3": "input",
  123494. "O": "output"
  123495. },
  123496. "connections": {
  123497. "I0": [ "0" ],
  123498. "I1": [ 5056 ],
  123499. "I2": [ 5021 ],
  123500. "I3": [ 4985 ],
  123501. "O": [ 5276 ]
  123502. }
  123503. },
  123504. "cpu_I.memory_MUL_LOW_SB_LUT4_O_16_I3_SB_CARRY_CO": {
  123505. "hide_name": 0,
  123506. "type": "SB_CARRY",
  123507. "parameters": {
  123508. },
  123509. "attributes": {
  123510. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123511. },
  123512. "port_directions": {
  123513. "CI": "input",
  123514. "CO": "output",
  123515. "I0": "input",
  123516. "I1": "input"
  123517. },
  123518. "connections": {
  123519. "CI": [ 5274 ],
  123520. "CO": [ 5278 ],
  123521. "I0": [ 5272 ],
  123522. "I1": [ 5273 ]
  123523. }
  123524. },
  123525. "cpu_I.memory_MUL_LOW_SB_LUT4_O_17": {
  123526. "hide_name": 0,
  123527. "type": "SB_LUT4",
  123528. "parameters": {
  123529. "LUT_INIT": "0110100110010110"
  123530. },
  123531. "attributes": {
  123532. "module_not_derived": "00000000000000000000000000000001",
  123533. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123534. },
  123535. "port_directions": {
  123536. "I0": "input",
  123537. "I1": "input",
  123538. "I2": "input",
  123539. "I3": "input",
  123540. "O": "output"
  123541. },
  123542. "connections": {
  123543. "I0": [ "0" ],
  123544. "I1": [ 5280 ],
  123545. "I2": [ 5281 ],
  123546. "I3": [ 5282 ],
  123547. "O": [ 5283 ]
  123548. }
  123549. },
  123550. "cpu_I.memory_MUL_LOW_SB_LUT4_O_17_I1_SB_LUT4_O": {
  123551. "hide_name": 0,
  123552. "type": "SB_LUT4",
  123553. "parameters": {
  123554. "LUT_INIT": "1111110011000000"
  123555. },
  123556. "attributes": {
  123557. "module_not_derived": "00000000000000000000000000000001",
  123558. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  123559. },
  123560. "port_directions": {
  123561. "I0": "input",
  123562. "I1": "input",
  123563. "I2": "input",
  123564. "I3": "input",
  123565. "O": "output"
  123566. },
  123567. "connections": {
  123568. "I0": [ "0" ],
  123569. "I1": [ 5056 ],
  123570. "I2": [ 5021 ],
  123571. "I3": [ 4985 ],
  123572. "O": [ 5281 ]
  123573. }
  123574. },
  123575. "cpu_I.memory_MUL_LOW_SB_LUT4_O_17_I1_SB_LUT4_O_1": {
  123576. "hide_name": 0,
  123577. "type": "SB_LUT4",
  123578. "parameters": {
  123579. "LUT_INIT": "0000111111110000"
  123580. },
  123581. "attributes": {
  123582. "module_not_derived": "00000000000000000000000000000001",
  123583. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123584. },
  123585. "port_directions": {
  123586. "I0": "input",
  123587. "I1": "input",
  123588. "I2": "input",
  123589. "I3": "input",
  123590. "O": "output"
  123591. },
  123592. "connections": {
  123593. "I0": [ "0" ],
  123594. "I1": [ "0" ],
  123595. "I2": [ 4995 ],
  123596. "I3": [ 4959 ],
  123597. "O": [ 5280 ]
  123598. }
  123599. },
  123600. "cpu_I.memory_MUL_LOW_SB_LUT4_O_17_I3_SB_CARRY_CO": {
  123601. "hide_name": 0,
  123602. "type": "SB_CARRY",
  123603. "parameters": {
  123604. },
  123605. "attributes": {
  123606. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123607. },
  123608. "port_directions": {
  123609. "CI": "input",
  123610. "CO": "output",
  123611. "I0": "input",
  123612. "I1": "input"
  123613. },
  123614. "connections": {
  123615. "CI": [ 5278 ],
  123616. "CO": [ 5282 ],
  123617. "I0": [ 5276 ],
  123618. "I1": [ 5277 ]
  123619. }
  123620. },
  123621. "cpu_I.memory_MUL_LOW_SB_LUT4_O_18": {
  123622. "hide_name": 0,
  123623. "type": "SB_LUT4",
  123624. "parameters": {
  123625. "LUT_INIT": "0110100110010110"
  123626. },
  123627. "attributes": {
  123628. "module_not_derived": "00000000000000000000000000000001",
  123629. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123630. },
  123631. "port_directions": {
  123632. "I0": "input",
  123633. "I1": "input",
  123634. "I2": "input",
  123635. "I3": "input",
  123636. "O": "output"
  123637. },
  123638. "connections": {
  123639. "I0": [ "0" ],
  123640. "I1": [ 5284 ],
  123641. "I2": [ 5285 ],
  123642. "I3": [ 5286 ],
  123643. "O": [ 5287 ]
  123644. }
  123645. },
  123646. "cpu_I.memory_MUL_LOW_SB_LUT4_O_18_I1_SB_LUT4_O": {
  123647. "hide_name": 0,
  123648. "type": "SB_LUT4",
  123649. "parameters": {
  123650. "LUT_INIT": "0000111111110000"
  123651. },
  123652. "attributes": {
  123653. "module_not_derived": "00000000000000000000000000000001",
  123654. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123655. },
  123656. "port_directions": {
  123657. "I0": "input",
  123658. "I1": "input",
  123659. "I2": "input",
  123660. "I3": "input",
  123661. "O": "output"
  123662. },
  123663. "connections": {
  123664. "I0": [ "0" ],
  123665. "I1": [ "0" ],
  123666. "I2": [ 4958 ],
  123667. "I3": [ 4994 ],
  123668. "O": [ 5284 ]
  123669. }
  123670. },
  123671. "cpu_I.memory_MUL_LOW_SB_LUT4_O_18_I1_SB_LUT4_O_1": {
  123672. "hide_name": 0,
  123673. "type": "SB_LUT4",
  123674. "parameters": {
  123675. "LUT_INIT": "1111000000000000"
  123676. },
  123677. "attributes": {
  123678. "module_not_derived": "00000000000000000000000000000001",
  123679. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123680. },
  123681. "port_directions": {
  123682. "I0": "input",
  123683. "I1": "input",
  123684. "I2": "input",
  123685. "I3": "input",
  123686. "O": "output"
  123687. },
  123688. "connections": {
  123689. "I0": [ "0" ],
  123690. "I1": [ "0" ],
  123691. "I2": [ 4995 ],
  123692. "I3": [ 4959 ],
  123693. "O": [ 5285 ]
  123694. }
  123695. },
  123696. "cpu_I.memory_MUL_LOW_SB_LUT4_O_18_I3_SB_CARRY_CO": {
  123697. "hide_name": 0,
  123698. "type": "SB_CARRY",
  123699. "parameters": {
  123700. },
  123701. "attributes": {
  123702. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123703. },
  123704. "port_directions": {
  123705. "CI": "input",
  123706. "CO": "output",
  123707. "I0": "input",
  123708. "I1": "input"
  123709. },
  123710. "connections": {
  123711. "CI": [ 5282 ],
  123712. "CO": [ 5286 ],
  123713. "I0": [ 5280 ],
  123714. "I1": [ 5281 ]
  123715. }
  123716. },
  123717. "cpu_I.memory_MUL_LOW_SB_LUT4_O_19": {
  123718. "hide_name": 0,
  123719. "type": "SB_LUT4",
  123720. "parameters": {
  123721. "LUT_INIT": "0110100110010110"
  123722. },
  123723. "attributes": {
  123724. "module_not_derived": "00000000000000000000000000000001",
  123725. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123726. },
  123727. "port_directions": {
  123728. "I0": "input",
  123729. "I1": "input",
  123730. "I2": "input",
  123731. "I3": "input",
  123732. "O": "output"
  123733. },
  123734. "connections": {
  123735. "I0": [ "0" ],
  123736. "I1": [ 5288 ],
  123737. "I2": [ 5289 ],
  123738. "I3": [ 5290 ],
  123739. "O": [ 5291 ]
  123740. }
  123741. },
  123742. "cpu_I.memory_MUL_LOW_SB_LUT4_O_19_I1_SB_LUT4_O": {
  123743. "hide_name": 0,
  123744. "type": "SB_LUT4",
  123745. "parameters": {
  123746. "LUT_INIT": "0000111111110000"
  123747. },
  123748. "attributes": {
  123749. "module_not_derived": "00000000000000000000000000000001",
  123750. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123751. },
  123752. "port_directions": {
  123753. "I0": "input",
  123754. "I1": "input",
  123755. "I2": "input",
  123756. "I3": "input",
  123757. "O": "output"
  123758. },
  123759. "connections": {
  123760. "I0": [ "0" ],
  123761. "I1": [ "0" ],
  123762. "I2": [ 4956 ],
  123763. "I3": [ 4992 ],
  123764. "O": [ 5288 ]
  123765. }
  123766. },
  123767. "cpu_I.memory_MUL_LOW_SB_LUT4_O_19_I1_SB_LUT4_O_1": {
  123768. "hide_name": 0,
  123769. "type": "SB_LUT4",
  123770. "parameters": {
  123771. "LUT_INIT": "1111000000000000"
  123772. },
  123773. "attributes": {
  123774. "module_not_derived": "00000000000000000000000000000001",
  123775. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123776. },
  123777. "port_directions": {
  123778. "I0": "input",
  123779. "I1": "input",
  123780. "I2": "input",
  123781. "I3": "input",
  123782. "O": "output"
  123783. },
  123784. "connections": {
  123785. "I0": [ "0" ],
  123786. "I1": [ "0" ],
  123787. "I2": [ 4993 ],
  123788. "I3": [ 4957 ],
  123789. "O": [ 5289 ]
  123790. }
  123791. },
  123792. "cpu_I.memory_MUL_LOW_SB_LUT4_O_19_I3_SB_CARRY_CO": {
  123793. "hide_name": 0,
  123794. "type": "SB_CARRY",
  123795. "parameters": {
  123796. },
  123797. "attributes": {
  123798. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123799. },
  123800. "port_directions": {
  123801. "CI": "input",
  123802. "CO": "output",
  123803. "I0": "input",
  123804. "I1": "input"
  123805. },
  123806. "connections": {
  123807. "CI": [ 5244 ],
  123808. "CO": [ 5290 ],
  123809. "I0": [ 5242 ],
  123810. "I1": [ 5243 ]
  123811. }
  123812. },
  123813. "cpu_I.memory_MUL_LOW_SB_LUT4_O_1_I1_SB_LUT4_O": {
  123814. "hide_name": 0,
  123815. "type": "SB_LUT4",
  123816. "parameters": {
  123817. "LUT_INIT": "0000111111110000"
  123818. },
  123819. "attributes": {
  123820. "module_not_derived": "00000000000000000000000000000001",
  123821. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123822. },
  123823. "port_directions": {
  123824. "I0": "input",
  123825. "I1": "input",
  123826. "I2": "input",
  123827. "I3": "input",
  123828. "O": "output"
  123829. },
  123830. "connections": {
  123831. "I0": [ "0" ],
  123832. "I1": [ "0" ],
  123833. "I2": [ 4987 ],
  123834. "I3": [ 4950 ],
  123835. "O": [ 5246 ]
  123836. }
  123837. },
  123838. "cpu_I.memory_MUL_LOW_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  123839. "hide_name": 0,
  123840. "type": "SB_CARRY",
  123841. "parameters": {
  123842. },
  123843. "attributes": {
  123844. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123845. },
  123846. "port_directions": {
  123847. "CI": "input",
  123848. "CO": "output",
  123849. "I0": "input",
  123850. "I1": "input"
  123851. },
  123852. "connections": {
  123853. "CI": [ 5292 ],
  123854. "CO": [ 5247 ],
  123855. "I0": [ 5246 ],
  123856. "I1": [ 5293 ]
  123857. }
  123858. },
  123859. "cpu_I.memory_MUL_LOW_SB_LUT4_O_2": {
  123860. "hide_name": 0,
  123861. "type": "SB_LUT4",
  123862. "parameters": {
  123863. "LUT_INIT": "0110100110010110"
  123864. },
  123865. "attributes": {
  123866. "module_not_derived": "00000000000000000000000000000001",
  123867. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123868. },
  123869. "port_directions": {
  123870. "I0": "input",
  123871. "I1": "input",
  123872. "I2": "input",
  123873. "I3": "input",
  123874. "O": "output"
  123875. },
  123876. "connections": {
  123877. "I0": [ "0" ],
  123878. "I1": [ 5294 ],
  123879. "I2": [ 5295 ],
  123880. "I3": [ "0" ],
  123881. "O": [ 5296 ]
  123882. }
  123883. },
  123884. "cpu_I.memory_MUL_LOW_SB_LUT4_O_20": {
  123885. "hide_name": 0,
  123886. "type": "SB_LUT4",
  123887. "parameters": {
  123888. "LUT_INIT": "0110100110010110"
  123889. },
  123890. "attributes": {
  123891. "module_not_derived": "00000000000000000000000000000001",
  123892. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123893. },
  123894. "port_directions": {
  123895. "I0": "input",
  123896. "I1": "input",
  123897. "I2": "input",
  123898. "I3": "input",
  123899. "O": "output"
  123900. },
  123901. "connections": {
  123902. "I0": [ "0" ],
  123903. "I1": [ 5297 ],
  123904. "I2": [ 5298 ],
  123905. "I3": [ 5299 ],
  123906. "O": [ 5300 ]
  123907. }
  123908. },
  123909. "cpu_I.memory_MUL_LOW_SB_LUT4_O_20_I1_SB_LUT4_O": {
  123910. "hide_name": 0,
  123911. "type": "SB_LUT4",
  123912. "parameters": {
  123913. "LUT_INIT": "0000111111110000"
  123914. },
  123915. "attributes": {
  123916. "module_not_derived": "00000000000000000000000000000001",
  123917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123918. },
  123919. "port_directions": {
  123920. "I0": "input",
  123921. "I1": "input",
  123922. "I2": "input",
  123923. "I3": "input",
  123924. "O": "output"
  123925. },
  123926. "connections": {
  123927. "I0": [ "0" ],
  123928. "I1": [ "0" ],
  123929. "I2": [ 4955 ],
  123930. "I3": [ 4991 ],
  123931. "O": [ 5297 ]
  123932. }
  123933. },
  123934. "cpu_I.memory_MUL_LOW_SB_LUT4_O_20_I1_SB_LUT4_O_1": {
  123935. "hide_name": 0,
  123936. "type": "SB_LUT4",
  123937. "parameters": {
  123938. "LUT_INIT": "1111000000000000"
  123939. },
  123940. "attributes": {
  123941. "module_not_derived": "00000000000000000000000000000001",
  123942. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  123943. },
  123944. "port_directions": {
  123945. "I0": "input",
  123946. "I1": "input",
  123947. "I2": "input",
  123948. "I3": "input",
  123949. "O": "output"
  123950. },
  123951. "connections": {
  123952. "I0": [ "0" ],
  123953. "I1": [ "0" ],
  123954. "I2": [ 4956 ],
  123955. "I3": [ 4992 ],
  123956. "O": [ 5298 ]
  123957. }
  123958. },
  123959. "cpu_I.memory_MUL_LOW_SB_LUT4_O_20_I3_SB_CARRY_CO": {
  123960. "hide_name": 0,
  123961. "type": "SB_CARRY",
  123962. "parameters": {
  123963. },
  123964. "attributes": {
  123965. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  123966. },
  123967. "port_directions": {
  123968. "CI": "input",
  123969. "CO": "output",
  123970. "I0": "input",
  123971. "I1": "input"
  123972. },
  123973. "connections": {
  123974. "CI": [ 5290 ],
  123975. "CO": [ 5299 ],
  123976. "I0": [ 5288 ],
  123977. "I1": [ 5289 ]
  123978. }
  123979. },
  123980. "cpu_I.memory_MUL_LOW_SB_LUT4_O_21": {
  123981. "hide_name": 0,
  123982. "type": "SB_LUT4",
  123983. "parameters": {
  123984. "LUT_INIT": "0110100110010110"
  123985. },
  123986. "attributes": {
  123987. "module_not_derived": "00000000000000000000000000000001",
  123988. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  123989. },
  123990. "port_directions": {
  123991. "I0": "input",
  123992. "I1": "input",
  123993. "I2": "input",
  123994. "I3": "input",
  123995. "O": "output"
  123996. },
  123997. "connections": {
  123998. "I0": [ "0" ],
  123999. "I1": [ 5301 ],
  124000. "I2": [ 5302 ],
  124001. "I3": [ 5303 ],
  124002. "O": [ 5304 ]
  124003. }
  124004. },
  124005. "cpu_I.memory_MUL_LOW_SB_LUT4_O_21_I1_SB_LUT4_O": {
  124006. "hide_name": 0,
  124007. "type": "SB_LUT4",
  124008. "parameters": {
  124009. "LUT_INIT": "0000111111110000"
  124010. },
  124011. "attributes": {
  124012. "module_not_derived": "00000000000000000000000000000001",
  124013. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124014. },
  124015. "port_directions": {
  124016. "I0": "input",
  124017. "I1": "input",
  124018. "I2": "input",
  124019. "I3": "input",
  124020. "O": "output"
  124021. },
  124022. "connections": {
  124023. "I0": [ "0" ],
  124024. "I1": [ "0" ],
  124025. "I2": [ 4990 ],
  124026. "I3": [ 4954 ],
  124027. "O": [ 5301 ]
  124028. }
  124029. },
  124030. "cpu_I.memory_MUL_LOW_SB_LUT4_O_21_I1_SB_LUT4_O_1": {
  124031. "hide_name": 0,
  124032. "type": "SB_LUT4",
  124033. "parameters": {
  124034. "LUT_INIT": "1111000000000000"
  124035. },
  124036. "attributes": {
  124037. "module_not_derived": "00000000000000000000000000000001",
  124038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124039. },
  124040. "port_directions": {
  124041. "I0": "input",
  124042. "I1": "input",
  124043. "I2": "input",
  124044. "I3": "input",
  124045. "O": "output"
  124046. },
  124047. "connections": {
  124048. "I0": [ "0" ],
  124049. "I1": [ "0" ],
  124050. "I2": [ 4955 ],
  124051. "I3": [ 4991 ],
  124052. "O": [ 5302 ]
  124053. }
  124054. },
  124055. "cpu_I.memory_MUL_LOW_SB_LUT4_O_21_I3_SB_CARRY_CO": {
  124056. "hide_name": 0,
  124057. "type": "SB_CARRY",
  124058. "parameters": {
  124059. },
  124060. "attributes": {
  124061. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124062. },
  124063. "port_directions": {
  124064. "CI": "input",
  124065. "CO": "output",
  124066. "I0": "input",
  124067. "I1": "input"
  124068. },
  124069. "connections": {
  124070. "CI": [ 5299 ],
  124071. "CO": [ 5303 ],
  124072. "I0": [ 5297 ],
  124073. "I1": [ 5298 ]
  124074. }
  124075. },
  124076. "cpu_I.memory_MUL_LOW_SB_LUT4_O_22": {
  124077. "hide_name": 0,
  124078. "type": "SB_LUT4",
  124079. "parameters": {
  124080. "LUT_INIT": "0110100110010110"
  124081. },
  124082. "attributes": {
  124083. "module_not_derived": "00000000000000000000000000000001",
  124084. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124085. },
  124086. "port_directions": {
  124087. "I0": "input",
  124088. "I1": "input",
  124089. "I2": "input",
  124090. "I3": "input",
  124091. "O": "output"
  124092. },
  124093. "connections": {
  124094. "I0": [ "0" ],
  124095. "I1": [ 5305 ],
  124096. "I2": [ 5306 ],
  124097. "I3": [ 5307 ],
  124098. "O": [ 5308 ]
  124099. }
  124100. },
  124101. "cpu_I.memory_MUL_LOW_SB_LUT4_O_22_I1_SB_LUT4_O": {
  124102. "hide_name": 0,
  124103. "type": "SB_LUT4",
  124104. "parameters": {
  124105. "LUT_INIT": "0000111111110000"
  124106. },
  124107. "attributes": {
  124108. "module_not_derived": "00000000000000000000000000000001",
  124109. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124110. },
  124111. "port_directions": {
  124112. "I0": "input",
  124113. "I1": "input",
  124114. "I2": "input",
  124115. "I3": "input",
  124116. "O": "output"
  124117. },
  124118. "connections": {
  124119. "I0": [ "0" ],
  124120. "I1": [ "0" ],
  124121. "I2": [ 4989 ],
  124122. "I3": [ 4953 ],
  124123. "O": [ 5305 ]
  124124. }
  124125. },
  124126. "cpu_I.memory_MUL_LOW_SB_LUT4_O_22_I1_SB_LUT4_O_1": {
  124127. "hide_name": 0,
  124128. "type": "SB_LUT4",
  124129. "parameters": {
  124130. "LUT_INIT": "1111000000000000"
  124131. },
  124132. "attributes": {
  124133. "module_not_derived": "00000000000000000000000000000001",
  124134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124135. },
  124136. "port_directions": {
  124137. "I0": "input",
  124138. "I1": "input",
  124139. "I2": "input",
  124140. "I3": "input",
  124141. "O": "output"
  124142. },
  124143. "connections": {
  124144. "I0": [ "0" ],
  124145. "I1": [ "0" ],
  124146. "I2": [ 4990 ],
  124147. "I3": [ 4954 ],
  124148. "O": [ 5306 ]
  124149. }
  124150. },
  124151. "cpu_I.memory_MUL_LOW_SB_LUT4_O_22_I3_SB_CARRY_CO": {
  124152. "hide_name": 0,
  124153. "type": "SB_CARRY",
  124154. "parameters": {
  124155. },
  124156. "attributes": {
  124157. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124158. },
  124159. "port_directions": {
  124160. "CI": "input",
  124161. "CO": "output",
  124162. "I0": "input",
  124163. "I1": "input"
  124164. },
  124165. "connections": {
  124166. "CI": [ 5303 ],
  124167. "CO": [ 5307 ],
  124168. "I0": [ 5301 ],
  124169. "I1": [ 5302 ]
  124170. }
  124171. },
  124172. "cpu_I.memory_MUL_LOW_SB_LUT4_O_23": {
  124173. "hide_name": 0,
  124174. "type": "SB_LUT4",
  124175. "parameters": {
  124176. "LUT_INIT": "0110100110010110"
  124177. },
  124178. "attributes": {
  124179. "module_not_derived": "00000000000000000000000000000001",
  124180. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124181. },
  124182. "port_directions": {
  124183. "I0": "input",
  124184. "I1": "input",
  124185. "I2": "input",
  124186. "I3": "input",
  124187. "O": "output"
  124188. },
  124189. "connections": {
  124190. "I0": [ "0" ],
  124191. "I1": [ 5309 ],
  124192. "I2": [ 5310 ],
  124193. "I3": [ 5311 ],
  124194. "O": [ 5312 ]
  124195. }
  124196. },
  124197. "cpu_I.memory_MUL_LOW_SB_LUT4_O_23_I1_SB_LUT4_O": {
  124198. "hide_name": 0,
  124199. "type": "SB_LUT4",
  124200. "parameters": {
  124201. "LUT_INIT": "0000111111110000"
  124202. },
  124203. "attributes": {
  124204. "module_not_derived": "00000000000000000000000000000001",
  124205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124206. },
  124207. "port_directions": {
  124208. "I0": "input",
  124209. "I1": "input",
  124210. "I2": "input",
  124211. "I3": "input",
  124212. "O": "output"
  124213. },
  124214. "connections": {
  124215. "I0": [ "0" ],
  124216. "I1": [ "0" ],
  124217. "I2": [ 4952 ],
  124218. "I3": [ 5003 ],
  124219. "O": [ 5309 ]
  124220. }
  124221. },
  124222. "cpu_I.memory_MUL_LOW_SB_LUT4_O_23_I1_SB_LUT4_O_1": {
  124223. "hide_name": 0,
  124224. "type": "SB_LUT4",
  124225. "parameters": {
  124226. "LUT_INIT": "1111000000000000"
  124227. },
  124228. "attributes": {
  124229. "module_not_derived": "00000000000000000000000000000001",
  124230. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124231. },
  124232. "port_directions": {
  124233. "I0": "input",
  124234. "I1": "input",
  124235. "I2": "input",
  124236. "I3": "input",
  124237. "O": "output"
  124238. },
  124239. "connections": {
  124240. "I0": [ "0" ],
  124241. "I1": [ "0" ],
  124242. "I2": [ 4989 ],
  124243. "I3": [ 4953 ],
  124244. "O": [ 5310 ]
  124245. }
  124246. },
  124247. "cpu_I.memory_MUL_LOW_SB_LUT4_O_23_I3_SB_CARRY_CO": {
  124248. "hide_name": 0,
  124249. "type": "SB_CARRY",
  124250. "parameters": {
  124251. },
  124252. "attributes": {
  124253. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124254. },
  124255. "port_directions": {
  124256. "CI": "input",
  124257. "CO": "output",
  124258. "I0": "input",
  124259. "I1": "input"
  124260. },
  124261. "connections": {
  124262. "CI": [ 5307 ],
  124263. "CO": [ 5311 ],
  124264. "I0": [ 5305 ],
  124265. "I1": [ 5306 ]
  124266. }
  124267. },
  124268. "cpu_I.memory_MUL_LOW_SB_LUT4_O_24": {
  124269. "hide_name": 0,
  124270. "type": "SB_LUT4",
  124271. "parameters": {
  124272. "LUT_INIT": "0110100110010110"
  124273. },
  124274. "attributes": {
  124275. "module_not_derived": "00000000000000000000000000000001",
  124276. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124277. },
  124278. "port_directions": {
  124279. "I0": "input",
  124280. "I1": "input",
  124281. "I2": "input",
  124282. "I3": "input",
  124283. "O": "output"
  124284. },
  124285. "connections": {
  124286. "I0": [ "0" ],
  124287. "I1": [ 5313 ],
  124288. "I2": [ 5314 ],
  124289. "I3": [ 5315 ],
  124290. "O": [ 5316 ]
  124291. }
  124292. },
  124293. "cpu_I.memory_MUL_LOW_SB_LUT4_O_24_I1_SB_LUT4_O": {
  124294. "hide_name": 0,
  124295. "type": "SB_LUT4",
  124296. "parameters": {
  124297. "LUT_INIT": "0000111111110000"
  124298. },
  124299. "attributes": {
  124300. "module_not_derived": "00000000000000000000000000000001",
  124301. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124302. },
  124303. "port_directions": {
  124304. "I0": "input",
  124305. "I1": "input",
  124306. "I2": "input",
  124307. "I3": "input",
  124308. "O": "output"
  124309. },
  124310. "connections": {
  124311. "I0": [ "0" ],
  124312. "I1": [ "0" ],
  124313. "I2": [ 4967 ],
  124314. "I3": [ 5002 ],
  124315. "O": [ 5313 ]
  124316. }
  124317. },
  124318. "cpu_I.memory_MUL_LOW_SB_LUT4_O_24_I1_SB_LUT4_O_1": {
  124319. "hide_name": 0,
  124320. "type": "SB_LUT4",
  124321. "parameters": {
  124322. "LUT_INIT": "1111000000000000"
  124323. },
  124324. "attributes": {
  124325. "module_not_derived": "00000000000000000000000000000001",
  124326. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124327. },
  124328. "port_directions": {
  124329. "I0": "input",
  124330. "I1": "input",
  124331. "I2": "input",
  124332. "I3": "input",
  124333. "O": "output"
  124334. },
  124335. "connections": {
  124336. "I0": [ "0" ],
  124337. "I1": [ "0" ],
  124338. "I2": [ 4952 ],
  124339. "I3": [ 5003 ],
  124340. "O": [ 5314 ]
  124341. }
  124342. },
  124343. "cpu_I.memory_MUL_LOW_SB_LUT4_O_24_I3_SB_CARRY_CO": {
  124344. "hide_name": 0,
  124345. "type": "SB_CARRY",
  124346. "parameters": {
  124347. },
  124348. "attributes": {
  124349. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124350. },
  124351. "port_directions": {
  124352. "CI": "input",
  124353. "CO": "output",
  124354. "I0": "input",
  124355. "I1": "input"
  124356. },
  124357. "connections": {
  124358. "CI": [ 5311 ],
  124359. "CO": [ 5315 ],
  124360. "I0": [ 5309 ],
  124361. "I1": [ 5310 ]
  124362. }
  124363. },
  124364. "cpu_I.memory_MUL_LOW_SB_LUT4_O_25": {
  124365. "hide_name": 0,
  124366. "type": "SB_LUT4",
  124367. "parameters": {
  124368. "LUT_INIT": "0110100110010110"
  124369. },
  124370. "attributes": {
  124371. "module_not_derived": "00000000000000000000000000000001",
  124372. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124373. },
  124374. "port_directions": {
  124375. "I0": "input",
  124376. "I1": "input",
  124377. "I2": "input",
  124378. "I3": "input",
  124379. "O": "output"
  124380. },
  124381. "connections": {
  124382. "I0": [ "0" ],
  124383. "I1": [ 5317 ],
  124384. "I2": [ 5318 ],
  124385. "I3": [ 5319 ],
  124386. "O": [ 5320 ]
  124387. }
  124388. },
  124389. "cpu_I.memory_MUL_LOW_SB_LUT4_O_25_I1_SB_LUT4_O": {
  124390. "hide_name": 0,
  124391. "type": "SB_LUT4",
  124392. "parameters": {
  124393. "LUT_INIT": "0000111111110000"
  124394. },
  124395. "attributes": {
  124396. "module_not_derived": "00000000000000000000000000000001",
  124397. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124398. },
  124399. "port_directions": {
  124400. "I0": "input",
  124401. "I1": "input",
  124402. "I2": "input",
  124403. "I3": "input",
  124404. "O": "output"
  124405. },
  124406. "connections": {
  124407. "I0": [ "0" ],
  124408. "I1": [ "0" ],
  124409. "I2": [ 5001 ],
  124410. "I3": [ 4966 ],
  124411. "O": [ 5317 ]
  124412. }
  124413. },
  124414. "cpu_I.memory_MUL_LOW_SB_LUT4_O_25_I1_SB_LUT4_O_1": {
  124415. "hide_name": 0,
  124416. "type": "SB_LUT4",
  124417. "parameters": {
  124418. "LUT_INIT": "1111000000000000"
  124419. },
  124420. "attributes": {
  124421. "module_not_derived": "00000000000000000000000000000001",
  124422. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124423. },
  124424. "port_directions": {
  124425. "I0": "input",
  124426. "I1": "input",
  124427. "I2": "input",
  124428. "I3": "input",
  124429. "O": "output"
  124430. },
  124431. "connections": {
  124432. "I0": [ "0" ],
  124433. "I1": [ "0" ],
  124434. "I2": [ 4967 ],
  124435. "I3": [ 5002 ],
  124436. "O": [ 5318 ]
  124437. }
  124438. },
  124439. "cpu_I.memory_MUL_LOW_SB_LUT4_O_25_I3_SB_CARRY_CO": {
  124440. "hide_name": 0,
  124441. "type": "SB_CARRY",
  124442. "parameters": {
  124443. },
  124444. "attributes": {
  124445. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124446. },
  124447. "port_directions": {
  124448. "CI": "input",
  124449. "CO": "output",
  124450. "I0": "input",
  124451. "I1": "input"
  124452. },
  124453. "connections": {
  124454. "CI": [ 5315 ],
  124455. "CO": [ 5319 ],
  124456. "I0": [ 5313 ],
  124457. "I1": [ 5314 ]
  124458. }
  124459. },
  124460. "cpu_I.memory_MUL_LOW_SB_LUT4_O_26": {
  124461. "hide_name": 0,
  124462. "type": "SB_LUT4",
  124463. "parameters": {
  124464. "LUT_INIT": "0110100110010110"
  124465. },
  124466. "attributes": {
  124467. "module_not_derived": "00000000000000000000000000000001",
  124468. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124469. },
  124470. "port_directions": {
  124471. "I0": "input",
  124472. "I1": "input",
  124473. "I2": "input",
  124474. "I3": "input",
  124475. "O": "output"
  124476. },
  124477. "connections": {
  124478. "I0": [ "0" ],
  124479. "I1": [ 5321 ],
  124480. "I2": [ 5322 ],
  124481. "I3": [ 5323 ],
  124482. "O": [ 5324 ]
  124483. }
  124484. },
  124485. "cpu_I.memory_MUL_LOW_SB_LUT4_O_26_I1_SB_LUT4_O": {
  124486. "hide_name": 0,
  124487. "type": "SB_LUT4",
  124488. "parameters": {
  124489. "LUT_INIT": "0000111111110000"
  124490. },
  124491. "attributes": {
  124492. "module_not_derived": "00000000000000000000000000000001",
  124493. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124494. },
  124495. "port_directions": {
  124496. "I0": "input",
  124497. "I1": "input",
  124498. "I2": "input",
  124499. "I3": "input",
  124500. "O": "output"
  124501. },
  124502. "connections": {
  124503. "I0": [ "0" ],
  124504. "I1": [ "0" ],
  124505. "I2": [ 4965 ],
  124506. "I3": [ 5000 ],
  124507. "O": [ 5321 ]
  124508. }
  124509. },
  124510. "cpu_I.memory_MUL_LOW_SB_LUT4_O_26_I1_SB_LUT4_O_1": {
  124511. "hide_name": 0,
  124512. "type": "SB_LUT4",
  124513. "parameters": {
  124514. "LUT_INIT": "1111000000000000"
  124515. },
  124516. "attributes": {
  124517. "module_not_derived": "00000000000000000000000000000001",
  124518. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124519. },
  124520. "port_directions": {
  124521. "I0": "input",
  124522. "I1": "input",
  124523. "I2": "input",
  124524. "I3": "input",
  124525. "O": "output"
  124526. },
  124527. "connections": {
  124528. "I0": [ "0" ],
  124529. "I1": [ "0" ],
  124530. "I2": [ 5001 ],
  124531. "I3": [ 4966 ],
  124532. "O": [ 5322 ]
  124533. }
  124534. },
  124535. "cpu_I.memory_MUL_LOW_SB_LUT4_O_26_I3_SB_CARRY_CO": {
  124536. "hide_name": 0,
  124537. "type": "SB_CARRY",
  124538. "parameters": {
  124539. },
  124540. "attributes": {
  124541. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124542. },
  124543. "port_directions": {
  124544. "CI": "input",
  124545. "CO": "output",
  124546. "I0": "input",
  124547. "I1": "input"
  124548. },
  124549. "connections": {
  124550. "CI": [ 5319 ],
  124551. "CO": [ 5323 ],
  124552. "I0": [ 5317 ],
  124553. "I1": [ 5318 ]
  124554. }
  124555. },
  124556. "cpu_I.memory_MUL_LOW_SB_LUT4_O_27": {
  124557. "hide_name": 0,
  124558. "type": "SB_LUT4",
  124559. "parameters": {
  124560. "LUT_INIT": "0110100110010110"
  124561. },
  124562. "attributes": {
  124563. "module_not_derived": "00000000000000000000000000000001",
  124564. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124565. },
  124566. "port_directions": {
  124567. "I0": "input",
  124568. "I1": "input",
  124569. "I2": "input",
  124570. "I3": "input",
  124571. "O": "output"
  124572. },
  124573. "connections": {
  124574. "I0": [ "0" ],
  124575. "I1": [ 5325 ],
  124576. "I2": [ 5326 ],
  124577. "I3": [ 5327 ],
  124578. "O": [ 5328 ]
  124579. }
  124580. },
  124581. "cpu_I.memory_MUL_LOW_SB_LUT4_O_27_I1_SB_LUT4_O": {
  124582. "hide_name": 0,
  124583. "type": "SB_LUT4",
  124584. "parameters": {
  124585. "LUT_INIT": "0000111111110000"
  124586. },
  124587. "attributes": {
  124588. "module_not_derived": "00000000000000000000000000000001",
  124589. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124590. },
  124591. "port_directions": {
  124592. "I0": "input",
  124593. "I1": "input",
  124594. "I2": "input",
  124595. "I3": "input",
  124596. "O": "output"
  124597. },
  124598. "connections": {
  124599. "I0": [ "0" ],
  124600. "I1": [ "0" ],
  124601. "I2": [ 4999 ],
  124602. "I3": [ 4964 ],
  124603. "O": [ 5325 ]
  124604. }
  124605. },
  124606. "cpu_I.memory_MUL_LOW_SB_LUT4_O_27_I1_SB_LUT4_O_1": {
  124607. "hide_name": 0,
  124608. "type": "SB_LUT4",
  124609. "parameters": {
  124610. "LUT_INIT": "1111000000000000"
  124611. },
  124612. "attributes": {
  124613. "module_not_derived": "00000000000000000000000000000001",
  124614. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124615. },
  124616. "port_directions": {
  124617. "I0": "input",
  124618. "I1": "input",
  124619. "I2": "input",
  124620. "I3": "input",
  124621. "O": "output"
  124622. },
  124623. "connections": {
  124624. "I0": [ "0" ],
  124625. "I1": [ "0" ],
  124626. "I2": [ 4965 ],
  124627. "I3": [ 5000 ],
  124628. "O": [ 5326 ]
  124629. }
  124630. },
  124631. "cpu_I.memory_MUL_LOW_SB_LUT4_O_27_I3_SB_CARRY_CO": {
  124632. "hide_name": 0,
  124633. "type": "SB_CARRY",
  124634. "parameters": {
  124635. },
  124636. "attributes": {
  124637. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124638. },
  124639. "port_directions": {
  124640. "CI": "input",
  124641. "CO": "output",
  124642. "I0": "input",
  124643. "I1": "input"
  124644. },
  124645. "connections": {
  124646. "CI": [ 5323 ],
  124647. "CO": [ 5327 ],
  124648. "I0": [ 5321 ],
  124649. "I1": [ 5322 ]
  124650. }
  124651. },
  124652. "cpu_I.memory_MUL_LOW_SB_LUT4_O_28": {
  124653. "hide_name": 0,
  124654. "type": "SB_LUT4",
  124655. "parameters": {
  124656. "LUT_INIT": "0110100110010110"
  124657. },
  124658. "attributes": {
  124659. "module_not_derived": "00000000000000000000000000000001",
  124660. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124661. },
  124662. "port_directions": {
  124663. "I0": "input",
  124664. "I1": "input",
  124665. "I2": "input",
  124666. "I3": "input",
  124667. "O": "output"
  124668. },
  124669. "connections": {
  124670. "I0": [ "0" ],
  124671. "I1": [ 5329 ],
  124672. "I2": [ 5330 ],
  124673. "I3": [ 5331 ],
  124674. "O": [ 5332 ]
  124675. }
  124676. },
  124677. "cpu_I.memory_MUL_LOW_SB_LUT4_O_28_I1_SB_LUT4_O": {
  124678. "hide_name": 0,
  124679. "type": "SB_LUT4",
  124680. "parameters": {
  124681. "LUT_INIT": "0000111111110000"
  124682. },
  124683. "attributes": {
  124684. "module_not_derived": "00000000000000000000000000000001",
  124685. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124686. },
  124687. "port_directions": {
  124688. "I0": "input",
  124689. "I1": "input",
  124690. "I2": "input",
  124691. "I3": "input",
  124692. "O": "output"
  124693. },
  124694. "connections": {
  124695. "I0": [ "0" ],
  124696. "I1": [ "0" ],
  124697. "I2": [ 4963 ],
  124698. "I3": [ 4998 ],
  124699. "O": [ 5329 ]
  124700. }
  124701. },
  124702. "cpu_I.memory_MUL_LOW_SB_LUT4_O_28_I1_SB_LUT4_O_1": {
  124703. "hide_name": 0,
  124704. "type": "SB_LUT4",
  124705. "parameters": {
  124706. "LUT_INIT": "1111000000000000"
  124707. },
  124708. "attributes": {
  124709. "module_not_derived": "00000000000000000000000000000001",
  124710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124711. },
  124712. "port_directions": {
  124713. "I0": "input",
  124714. "I1": "input",
  124715. "I2": "input",
  124716. "I3": "input",
  124717. "O": "output"
  124718. },
  124719. "connections": {
  124720. "I0": [ "0" ],
  124721. "I1": [ "0" ],
  124722. "I2": [ 4999 ],
  124723. "I3": [ 4964 ],
  124724. "O": [ 5330 ]
  124725. }
  124726. },
  124727. "cpu_I.memory_MUL_LOW_SB_LUT4_O_28_I3_SB_CARRY_CO": {
  124728. "hide_name": 0,
  124729. "type": "SB_CARRY",
  124730. "parameters": {
  124731. },
  124732. "attributes": {
  124733. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124734. },
  124735. "port_directions": {
  124736. "CI": "input",
  124737. "CO": "output",
  124738. "I0": "input",
  124739. "I1": "input"
  124740. },
  124741. "connections": {
  124742. "CI": [ 5327 ],
  124743. "CO": [ 5331 ],
  124744. "I0": [ 5325 ],
  124745. "I1": [ 5326 ]
  124746. }
  124747. },
  124748. "cpu_I.memory_MUL_LOW_SB_LUT4_O_29": {
  124749. "hide_name": 0,
  124750. "type": "SB_LUT4",
  124751. "parameters": {
  124752. "LUT_INIT": "0110100110010110"
  124753. },
  124754. "attributes": {
  124755. "module_not_derived": "00000000000000000000000000000001",
  124756. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124757. },
  124758. "port_directions": {
  124759. "I0": "input",
  124760. "I1": "input",
  124761. "I2": "input",
  124762. "I3": "input",
  124763. "O": "output"
  124764. },
  124765. "connections": {
  124766. "I0": [ "0" ],
  124767. "I1": [ 5333 ],
  124768. "I2": [ 5334 ],
  124769. "I3": [ 5335 ],
  124770. "O": [ 5336 ]
  124771. }
  124772. },
  124773. "cpu_I.memory_MUL_LOW_SB_LUT4_O_29_I1_SB_LUT4_O": {
  124774. "hide_name": 0,
  124775. "type": "SB_LUT4",
  124776. "parameters": {
  124777. "LUT_INIT": "0000111111110000"
  124778. },
  124779. "attributes": {
  124780. "module_not_derived": "00000000000000000000000000000001",
  124781. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124782. },
  124783. "port_directions": {
  124784. "I0": "input",
  124785. "I1": "input",
  124786. "I2": "input",
  124787. "I3": "input",
  124788. "O": "output"
  124789. },
  124790. "connections": {
  124791. "I0": [ "0" ],
  124792. "I1": [ "0" ],
  124793. "I2": [ 4997 ],
  124794. "I3": [ 4962 ],
  124795. "O": [ 5333 ]
  124796. }
  124797. },
  124798. "cpu_I.memory_MUL_LOW_SB_LUT4_O_29_I1_SB_LUT4_O_1": {
  124799. "hide_name": 0,
  124800. "type": "SB_LUT4",
  124801. "parameters": {
  124802. "LUT_INIT": "1111000000000000"
  124803. },
  124804. "attributes": {
  124805. "module_not_derived": "00000000000000000000000000000001",
  124806. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124807. },
  124808. "port_directions": {
  124809. "I0": "input",
  124810. "I1": "input",
  124811. "I2": "input",
  124812. "I3": "input",
  124813. "O": "output"
  124814. },
  124815. "connections": {
  124816. "I0": [ "0" ],
  124817. "I1": [ "0" ],
  124818. "I2": [ 4963 ],
  124819. "I3": [ 4998 ],
  124820. "O": [ 5334 ]
  124821. }
  124822. },
  124823. "cpu_I.memory_MUL_LOW_SB_LUT4_O_29_I3_SB_CARRY_CO": {
  124824. "hide_name": 0,
  124825. "type": "SB_CARRY",
  124826. "parameters": {
  124827. },
  124828. "attributes": {
  124829. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  124830. },
  124831. "port_directions": {
  124832. "CI": "input",
  124833. "CO": "output",
  124834. "I0": "input",
  124835. "I1": "input"
  124836. },
  124837. "connections": {
  124838. "CI": [ 5331 ],
  124839. "CO": [ 5335 ],
  124840. "I0": [ 5329 ],
  124841. "I1": [ 5330 ]
  124842. }
  124843. },
  124844. "cpu_I.memory_MUL_LOW_SB_LUT4_O_2_I1_SB_LUT4_O": {
  124845. "hide_name": 0,
  124846. "type": "SB_LUT4",
  124847. "parameters": {
  124848. "LUT_INIT": "1111110011000000"
  124849. },
  124850. "attributes": {
  124851. "module_not_derived": "00000000000000000000000000000001",
  124852. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  124853. },
  124854. "port_directions": {
  124855. "I0": "input",
  124856. "I1": "input",
  124857. "I2": "input",
  124858. "I3": "input",
  124859. "O": "output"
  124860. },
  124861. "connections": {
  124862. "I0": [ "0" ],
  124863. "I1": [ 5041 ],
  124864. "I2": [ 5006 ],
  124865. "I3": [ 4970 ],
  124866. "O": [ 5295 ]
  124867. }
  124868. },
  124869. "cpu_I.memory_MUL_LOW_SB_LUT4_O_2_I1_SB_LUT4_O_1": {
  124870. "hide_name": 0,
  124871. "type": "SB_LUT4",
  124872. "parameters": {
  124873. "LUT_INIT": "1100001100111100"
  124874. },
  124875. "attributes": {
  124876. "module_not_derived": "00000000000000000000000000000001",
  124877. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  124878. },
  124879. "port_directions": {
  124880. "I0": "input",
  124881. "I1": "input",
  124882. "I2": "input",
  124883. "I3": "input",
  124884. "O": "output"
  124885. },
  124886. "connections": {
  124887. "I0": [ "0" ],
  124888. "I1": [ 5042 ],
  124889. "I2": [ 4971 ],
  124890. "I3": [ 5007 ],
  124891. "O": [ 5294 ]
  124892. }
  124893. },
  124894. "cpu_I.memory_MUL_LOW_SB_LUT4_O_3": {
  124895. "hide_name": 0,
  124896. "type": "SB_LUT4",
  124897. "parameters": {
  124898. "LUT_INIT": "0110100110010110"
  124899. },
  124900. "attributes": {
  124901. "module_not_derived": "00000000000000000000000000000001",
  124902. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124903. },
  124904. "port_directions": {
  124905. "I0": "input",
  124906. "I1": "input",
  124907. "I2": "input",
  124908. "I3": "input",
  124909. "O": "output"
  124910. },
  124911. "connections": {
  124912. "I0": [ "0" ],
  124913. "I1": [ 5337 ],
  124914. "I2": [ 5338 ],
  124915. "I3": [ 5339 ],
  124916. "O": [ 5340 ]
  124917. }
  124918. },
  124919. "cpu_I.memory_MUL_LOW_SB_LUT4_O_30": {
  124920. "hide_name": 0,
  124921. "type": "SB_LUT4",
  124922. "parameters": {
  124923. "LUT_INIT": "0110100110010110"
  124924. },
  124925. "attributes": {
  124926. "module_not_derived": "00000000000000000000000000000001",
  124927. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  124928. },
  124929. "port_directions": {
  124930. "I0": "input",
  124931. "I1": "input",
  124932. "I2": "input",
  124933. "I3": "input",
  124934. "O": "output"
  124935. },
  124936. "connections": {
  124937. "I0": [ "0" ],
  124938. "I1": [ 5341 ],
  124939. "I2": [ 5342 ],
  124940. "I3": [ 5343 ],
  124941. "O": [ 5344 ]
  124942. }
  124943. },
  124944. "cpu_I.memory_MUL_LOW_SB_LUT4_O_30_I1_SB_LUT4_O": {
  124945. "hide_name": 0,
  124946. "type": "SB_LUT4",
  124947. "parameters": {
  124948. "LUT_INIT": "0000111111110000"
  124949. },
  124950. "attributes": {
  124951. "module_not_derived": "00000000000000000000000000000001",
  124952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124953. },
  124954. "port_directions": {
  124955. "I0": "input",
  124956. "I1": "input",
  124957. "I2": "input",
  124958. "I3": "input",
  124959. "O": "output"
  124960. },
  124961. "connections": {
  124962. "I0": [ "0" ],
  124963. "I1": [ "0" ],
  124964. "I2": [ 4961 ],
  124965. "I3": [ 4996 ],
  124966. "O": [ 5341 ]
  124967. }
  124968. },
  124969. "cpu_I.memory_MUL_LOW_SB_LUT4_O_30_I1_SB_LUT4_O_1": {
  124970. "hide_name": 0,
  124971. "type": "SB_LUT4",
  124972. "parameters": {
  124973. "LUT_INIT": "1111000000000000"
  124974. },
  124975. "attributes": {
  124976. "module_not_derived": "00000000000000000000000000000001",
  124977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  124978. },
  124979. "port_directions": {
  124980. "I0": "input",
  124981. "I1": "input",
  124982. "I2": "input",
  124983. "I3": "input",
  124984. "O": "output"
  124985. },
  124986. "connections": {
  124987. "I0": [ "0" ],
  124988. "I1": [ "0" ],
  124989. "I2": [ 4997 ],
  124990. "I3": [ 4962 ],
  124991. "O": [ 5342 ]
  124992. }
  124993. },
  124994. "cpu_I.memory_MUL_LOW_SB_LUT4_O_30_I3_SB_CARRY_CO": {
  124995. "hide_name": 0,
  124996. "type": "SB_CARRY",
  124997. "parameters": {
  124998. },
  124999. "attributes": {
  125000. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125001. },
  125002. "port_directions": {
  125003. "CI": "input",
  125004. "CO": "output",
  125005. "I0": "input",
  125006. "I1": "input"
  125007. },
  125008. "connections": {
  125009. "CI": [ 5335 ],
  125010. "CO": [ 5343 ],
  125011. "I0": [ 5333 ],
  125012. "I1": [ 5334 ]
  125013. }
  125014. },
  125015. "cpu_I.memory_MUL_LOW_SB_LUT4_O_31": {
  125016. "hide_name": 0,
  125017. "type": "SB_LUT4",
  125018. "parameters": {
  125019. "LUT_INIT": "0110100110010110"
  125020. },
  125021. "attributes": {
  125022. "module_not_derived": "00000000000000000000000000000001",
  125023. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125024. },
  125025. "port_directions": {
  125026. "I0": "input",
  125027. "I1": "input",
  125028. "I2": "input",
  125029. "I3": "input",
  125030. "O": "output"
  125031. },
  125032. "connections": {
  125033. "I0": [ "0" ],
  125034. "I1": [ 5345 ],
  125035. "I2": [ 5346 ],
  125036. "I3": [ 5347 ],
  125037. "O": [ 5348 ]
  125038. }
  125039. },
  125040. "cpu_I.memory_MUL_LOW_SB_LUT4_O_31_I1_SB_LUT4_O": {
  125041. "hide_name": 0,
  125042. "type": "SB_LUT4",
  125043. "parameters": {
  125044. "LUT_INIT": "0000111111110000"
  125045. },
  125046. "attributes": {
  125047. "module_not_derived": "00000000000000000000000000000001",
  125048. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125049. },
  125050. "port_directions": {
  125051. "I0": "input",
  125052. "I1": "input",
  125053. "I2": "input",
  125054. "I3": "input",
  125055. "O": "output"
  125056. },
  125057. "connections": {
  125058. "I0": [ "0" ],
  125059. "I1": [ "0" ],
  125060. "I2": [ 4988 ],
  125061. "I3": [ 4960 ],
  125062. "O": [ 5345 ]
  125063. }
  125064. },
  125065. "cpu_I.memory_MUL_LOW_SB_LUT4_O_31_I1_SB_LUT4_O_1": {
  125066. "hide_name": 0,
  125067. "type": "SB_LUT4",
  125068. "parameters": {
  125069. "LUT_INIT": "1111000000000000"
  125070. },
  125071. "attributes": {
  125072. "module_not_derived": "00000000000000000000000000000001",
  125073. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125074. },
  125075. "port_directions": {
  125076. "I0": "input",
  125077. "I1": "input",
  125078. "I2": "input",
  125079. "I3": "input",
  125080. "O": "output"
  125081. },
  125082. "connections": {
  125083. "I0": [ "0" ],
  125084. "I1": [ "0" ],
  125085. "I2": [ 4961 ],
  125086. "I3": [ 4996 ],
  125087. "O": [ 5346 ]
  125088. }
  125089. },
  125090. "cpu_I.memory_MUL_LOW_SB_LUT4_O_31_I3_SB_CARRY_CO": {
  125091. "hide_name": 0,
  125092. "type": "SB_CARRY",
  125093. "parameters": {
  125094. },
  125095. "attributes": {
  125096. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125097. },
  125098. "port_directions": {
  125099. "CI": "input",
  125100. "CO": "output",
  125101. "I0": "input",
  125102. "I1": "input"
  125103. },
  125104. "connections": {
  125105. "CI": [ 5343 ],
  125106. "CO": [ 5347 ],
  125107. "I0": [ 5341 ],
  125108. "I1": [ 5342 ]
  125109. }
  125110. },
  125111. "cpu_I.memory_MUL_LOW_SB_LUT4_O_32": {
  125112. "hide_name": 0,
  125113. "type": "SB_LUT4",
  125114. "parameters": {
  125115. "LUT_INIT": "0110100110010110"
  125116. },
  125117. "attributes": {
  125118. "module_not_derived": "00000000000000000000000000000001",
  125119. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125120. },
  125121. "port_directions": {
  125122. "I0": "input",
  125123. "I1": "input",
  125124. "I2": "input",
  125125. "I3": "input",
  125126. "O": "output"
  125127. },
  125128. "connections": {
  125129. "I0": [ "0" ],
  125130. "I1": [ 5349 ],
  125131. "I2": [ 5350 ],
  125132. "I3": [ 5351 ],
  125133. "O": [ 5352 ]
  125134. }
  125135. },
  125136. "cpu_I.memory_MUL_LOW_SB_LUT4_O_32_I1_SB_LUT4_O": {
  125137. "hide_name": 0,
  125138. "type": "SB_LUT4",
  125139. "parameters": {
  125140. "LUT_INIT": "0000111111110000"
  125141. },
  125142. "attributes": {
  125143. "module_not_derived": "00000000000000000000000000000001",
  125144. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125145. },
  125146. "port_directions": {
  125147. "I0": "input",
  125148. "I1": "input",
  125149. "I2": "input",
  125150. "I3": "input",
  125151. "O": "output"
  125152. },
  125153. "connections": {
  125154. "I0": [ "0" ],
  125155. "I1": [ "0" ],
  125156. "I2": [ 4987 ],
  125157. "I3": [ 4951 ],
  125158. "O": [ 5349 ]
  125159. }
  125160. },
  125161. "cpu_I.memory_MUL_LOW_SB_LUT4_O_32_I1_SB_LUT4_O_1": {
  125162. "hide_name": 0,
  125163. "type": "SB_LUT4",
  125164. "parameters": {
  125165. "LUT_INIT": "1111000000000000"
  125166. },
  125167. "attributes": {
  125168. "module_not_derived": "00000000000000000000000000000001",
  125169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125170. },
  125171. "port_directions": {
  125172. "I0": "input",
  125173. "I1": "input",
  125174. "I2": "input",
  125175. "I3": "input",
  125176. "O": "output"
  125177. },
  125178. "connections": {
  125179. "I0": [ "0" ],
  125180. "I1": [ "0" ],
  125181. "I2": [ 4988 ],
  125182. "I3": [ 4960 ],
  125183. "O": [ 5350 ]
  125184. }
  125185. },
  125186. "cpu_I.memory_MUL_LOW_SB_LUT4_O_32_I3_SB_CARRY_CO": {
  125187. "hide_name": 0,
  125188. "type": "SB_CARRY",
  125189. "parameters": {
  125190. },
  125191. "attributes": {
  125192. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125193. },
  125194. "port_directions": {
  125195. "CI": "input",
  125196. "CO": "output",
  125197. "I0": "input",
  125198. "I1": "input"
  125199. },
  125200. "connections": {
  125201. "CI": [ 5347 ],
  125202. "CO": [ 5351 ],
  125203. "I0": [ 5345 ],
  125204. "I1": [ 5346 ]
  125205. }
  125206. },
  125207. "cpu_I.memory_MUL_LOW_SB_LUT4_O_33": {
  125208. "hide_name": 0,
  125209. "type": "SB_LUT4",
  125210. "parameters": {
  125211. "LUT_INIT": "0110100110010110"
  125212. },
  125213. "attributes": {
  125214. "module_not_derived": "00000000000000000000000000000001",
  125215. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125216. },
  125217. "port_directions": {
  125218. "I0": "input",
  125219. "I1": "input",
  125220. "I2": "input",
  125221. "I3": "input",
  125222. "O": "output"
  125223. },
  125224. "connections": {
  125225. "I0": [ "0" ],
  125226. "I1": [ 5246 ],
  125227. "I2": [ 5293 ],
  125228. "I3": [ 5292 ],
  125229. "O": [ 5353 ]
  125230. }
  125231. },
  125232. "cpu_I.memory_MUL_LOW_SB_LUT4_O_33_I2_SB_LUT4_O": {
  125233. "hide_name": 0,
  125234. "type": "SB_LUT4",
  125235. "parameters": {
  125236. "LUT_INIT": "1111000000000000"
  125237. },
  125238. "attributes": {
  125239. "module_not_derived": "00000000000000000000000000000001",
  125240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125241. },
  125242. "port_directions": {
  125243. "I0": "input",
  125244. "I1": "input",
  125245. "I2": "input",
  125246. "I3": "input",
  125247. "O": "output"
  125248. },
  125249. "connections": {
  125250. "I0": [ "0" ],
  125251. "I1": [ "0" ],
  125252. "I2": [ 4987 ],
  125253. "I3": [ 4951 ],
  125254. "O": [ 5293 ]
  125255. }
  125256. },
  125257. "cpu_I.memory_MUL_LOW_SB_LUT4_O_33_I3_SB_CARRY_CO": {
  125258. "hide_name": 0,
  125259. "type": "SB_CARRY",
  125260. "parameters": {
  125261. },
  125262. "attributes": {
  125263. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125264. },
  125265. "port_directions": {
  125266. "CI": "input",
  125267. "CO": "output",
  125268. "I0": "input",
  125269. "I1": "input"
  125270. },
  125271. "connections": {
  125272. "CI": [ 5351 ],
  125273. "CO": [ 5292 ],
  125274. "I0": [ 5349 ],
  125275. "I1": [ 5350 ]
  125276. }
  125277. },
  125278. "cpu_I.memory_MUL_LOW_SB_LUT4_O_34": {
  125279. "hide_name": 0,
  125280. "type": "SB_LUT4",
  125281. "parameters": {
  125282. "LUT_INIT": "1100001100111100"
  125283. },
  125284. "attributes": {
  125285. "module_not_derived": "00000000000000000000000000000001",
  125286. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125287. },
  125288. "port_directions": {
  125289. "I0": "input",
  125290. "I1": "input",
  125291. "I2": "input",
  125292. "I3": "input",
  125293. "O": "output"
  125294. },
  125295. "connections": {
  125296. "I0": [ "0" ],
  125297. "I1": [ 5041 ],
  125298. "I2": [ 5006 ],
  125299. "I3": [ 4970 ],
  125300. "O": [ 5354 ]
  125301. }
  125302. },
  125303. "cpu_I.memory_MUL_LOW_SB_LUT4_O_3_I1_SB_LUT4_O": {
  125304. "hide_name": 0,
  125305. "type": "SB_LUT4",
  125306. "parameters": {
  125307. "LUT_INIT": "1111110011000000"
  125308. },
  125309. "attributes": {
  125310. "module_not_derived": "00000000000000000000000000000001",
  125311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125312. },
  125313. "port_directions": {
  125314. "I0": "input",
  125315. "I1": "input",
  125316. "I2": "input",
  125317. "I3": "input",
  125318. "O": "output"
  125319. },
  125320. "connections": {
  125321. "I0": [ "0" ],
  125322. "I1": [ 5042 ],
  125323. "I2": [ 4971 ],
  125324. "I3": [ 5007 ],
  125325. "O": [ 5338 ]
  125326. }
  125327. },
  125328. "cpu_I.memory_MUL_LOW_SB_LUT4_O_3_I1_SB_LUT4_O_1": {
  125329. "hide_name": 0,
  125330. "type": "SB_LUT4",
  125331. "parameters": {
  125332. "LUT_INIT": "1100001100111100"
  125333. },
  125334. "attributes": {
  125335. "module_not_derived": "00000000000000000000000000000001",
  125336. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125337. },
  125338. "port_directions": {
  125339. "I0": "input",
  125340. "I1": "input",
  125341. "I2": "input",
  125342. "I3": "input",
  125343. "O": "output"
  125344. },
  125345. "connections": {
  125346. "I0": [ "0" ],
  125347. "I1": [ 5043 ],
  125348. "I2": [ 4972 ],
  125349. "I3": [ 5008 ],
  125350. "O": [ 5337 ]
  125351. }
  125352. },
  125353. "cpu_I.memory_MUL_LOW_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  125354. "hide_name": 0,
  125355. "type": "SB_CARRY",
  125356. "parameters": {
  125357. },
  125358. "attributes": {
  125359. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125360. },
  125361. "port_directions": {
  125362. "CI": "input",
  125363. "CO": "output",
  125364. "I0": "input",
  125365. "I1": "input"
  125366. },
  125367. "connections": {
  125368. "CI": [ "0" ],
  125369. "CO": [ 5339 ],
  125370. "I0": [ 5294 ],
  125371. "I1": [ 5295 ]
  125372. }
  125373. },
  125374. "cpu_I.memory_MUL_LOW_SB_LUT4_O_4": {
  125375. "hide_name": 0,
  125376. "type": "SB_LUT4",
  125377. "parameters": {
  125378. "LUT_INIT": "0110100110010110"
  125379. },
  125380. "attributes": {
  125381. "module_not_derived": "00000000000000000000000000000001",
  125382. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125383. },
  125384. "port_directions": {
  125385. "I0": "input",
  125386. "I1": "input",
  125387. "I2": "input",
  125388. "I3": "input",
  125389. "O": "output"
  125390. },
  125391. "connections": {
  125392. "I0": [ "0" ],
  125393. "I1": [ 5355 ],
  125394. "I2": [ 5356 ],
  125395. "I3": [ 5357 ],
  125396. "O": [ 5358 ]
  125397. }
  125398. },
  125399. "cpu_I.memory_MUL_LOW_SB_LUT4_O_4_I1_SB_LUT4_O": {
  125400. "hide_name": 0,
  125401. "type": "SB_LUT4",
  125402. "parameters": {
  125403. "LUT_INIT": "1111110011000000"
  125404. },
  125405. "attributes": {
  125406. "module_not_derived": "00000000000000000000000000000001",
  125407. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125408. },
  125409. "port_directions": {
  125410. "I0": "input",
  125411. "I1": "input",
  125412. "I2": "input",
  125413. "I3": "input",
  125414. "O": "output"
  125415. },
  125416. "connections": {
  125417. "I0": [ "0" ],
  125418. "I1": [ 5043 ],
  125419. "I2": [ 4972 ],
  125420. "I3": [ 5008 ],
  125421. "O": [ 5356 ]
  125422. }
  125423. },
  125424. "cpu_I.memory_MUL_LOW_SB_LUT4_O_4_I1_SB_LUT4_O_1": {
  125425. "hide_name": 0,
  125426. "type": "SB_LUT4",
  125427. "parameters": {
  125428. "LUT_INIT": "1100001100111100"
  125429. },
  125430. "attributes": {
  125431. "module_not_derived": "00000000000000000000000000000001",
  125432. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125433. },
  125434. "port_directions": {
  125435. "I0": "input",
  125436. "I1": "input",
  125437. "I2": "input",
  125438. "I3": "input",
  125439. "O": "output"
  125440. },
  125441. "connections": {
  125442. "I0": [ "0" ],
  125443. "I1": [ 5044 ],
  125444. "I2": [ 5009 ],
  125445. "I3": [ 4973 ],
  125446. "O": [ 5355 ]
  125447. }
  125448. },
  125449. "cpu_I.memory_MUL_LOW_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  125450. "hide_name": 0,
  125451. "type": "SB_CARRY",
  125452. "parameters": {
  125453. },
  125454. "attributes": {
  125455. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125456. },
  125457. "port_directions": {
  125458. "CI": "input",
  125459. "CO": "output",
  125460. "I0": "input",
  125461. "I1": "input"
  125462. },
  125463. "connections": {
  125464. "CI": [ 5339 ],
  125465. "CO": [ 5357 ],
  125466. "I0": [ 5337 ],
  125467. "I1": [ 5338 ]
  125468. }
  125469. },
  125470. "cpu_I.memory_MUL_LOW_SB_LUT4_O_5": {
  125471. "hide_name": 0,
  125472. "type": "SB_LUT4",
  125473. "parameters": {
  125474. "LUT_INIT": "0110100110010110"
  125475. },
  125476. "attributes": {
  125477. "module_not_derived": "00000000000000000000000000000001",
  125478. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125479. },
  125480. "port_directions": {
  125481. "I0": "input",
  125482. "I1": "input",
  125483. "I2": "input",
  125484. "I3": "input",
  125485. "O": "output"
  125486. },
  125487. "connections": {
  125488. "I0": [ "0" ],
  125489. "I1": [ 5359 ],
  125490. "I2": [ 5360 ],
  125491. "I3": [ 5361 ],
  125492. "O": [ 5362 ]
  125493. }
  125494. },
  125495. "cpu_I.memory_MUL_LOW_SB_LUT4_O_5_I1_SB_LUT4_O": {
  125496. "hide_name": 0,
  125497. "type": "SB_LUT4",
  125498. "parameters": {
  125499. "LUT_INIT": "1111110011000000"
  125500. },
  125501. "attributes": {
  125502. "module_not_derived": "00000000000000000000000000000001",
  125503. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125504. },
  125505. "port_directions": {
  125506. "I0": "input",
  125507. "I1": "input",
  125508. "I2": "input",
  125509. "I3": "input",
  125510. "O": "output"
  125511. },
  125512. "connections": {
  125513. "I0": [ "0" ],
  125514. "I1": [ 5044 ],
  125515. "I2": [ 5009 ],
  125516. "I3": [ 4973 ],
  125517. "O": [ 5360 ]
  125518. }
  125519. },
  125520. "cpu_I.memory_MUL_LOW_SB_LUT4_O_5_I1_SB_LUT4_O_1": {
  125521. "hide_name": 0,
  125522. "type": "SB_LUT4",
  125523. "parameters": {
  125524. "LUT_INIT": "1100001100111100"
  125525. },
  125526. "attributes": {
  125527. "module_not_derived": "00000000000000000000000000000001",
  125528. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125529. },
  125530. "port_directions": {
  125531. "I0": "input",
  125532. "I1": "input",
  125533. "I2": "input",
  125534. "I3": "input",
  125535. "O": "output"
  125536. },
  125537. "connections": {
  125538. "I0": [ "0" ],
  125539. "I1": [ 5045 ],
  125540. "I2": [ 4974 ],
  125541. "I3": [ 5010 ],
  125542. "O": [ 5359 ]
  125543. }
  125544. },
  125545. "cpu_I.memory_MUL_LOW_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  125546. "hide_name": 0,
  125547. "type": "SB_CARRY",
  125548. "parameters": {
  125549. },
  125550. "attributes": {
  125551. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125552. },
  125553. "port_directions": {
  125554. "CI": "input",
  125555. "CO": "output",
  125556. "I0": "input",
  125557. "I1": "input"
  125558. },
  125559. "connections": {
  125560. "CI": [ 5357 ],
  125561. "CO": [ 5361 ],
  125562. "I0": [ 5355 ],
  125563. "I1": [ 5356 ]
  125564. }
  125565. },
  125566. "cpu_I.memory_MUL_LOW_SB_LUT4_O_6": {
  125567. "hide_name": 0,
  125568. "type": "SB_LUT4",
  125569. "parameters": {
  125570. "LUT_INIT": "0110100110010110"
  125571. },
  125572. "attributes": {
  125573. "module_not_derived": "00000000000000000000000000000001",
  125574. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125575. },
  125576. "port_directions": {
  125577. "I0": "input",
  125578. "I1": "input",
  125579. "I2": "input",
  125580. "I3": "input",
  125581. "O": "output"
  125582. },
  125583. "connections": {
  125584. "I0": [ "0" ],
  125585. "I1": [ 5363 ],
  125586. "I2": [ 5364 ],
  125587. "I3": [ 5365 ],
  125588. "O": [ 5366 ]
  125589. }
  125590. },
  125591. "cpu_I.memory_MUL_LOW_SB_LUT4_O_6_I1_SB_LUT4_O": {
  125592. "hide_name": 0,
  125593. "type": "SB_LUT4",
  125594. "parameters": {
  125595. "LUT_INIT": "1111110011000000"
  125596. },
  125597. "attributes": {
  125598. "module_not_derived": "00000000000000000000000000000001",
  125599. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125600. },
  125601. "port_directions": {
  125602. "I0": "input",
  125603. "I1": "input",
  125604. "I2": "input",
  125605. "I3": "input",
  125606. "O": "output"
  125607. },
  125608. "connections": {
  125609. "I0": [ "0" ],
  125610. "I1": [ 5045 ],
  125611. "I2": [ 4974 ],
  125612. "I3": [ 5010 ],
  125613. "O": [ 5364 ]
  125614. }
  125615. },
  125616. "cpu_I.memory_MUL_LOW_SB_LUT4_O_6_I1_SB_LUT4_O_1": {
  125617. "hide_name": 0,
  125618. "type": "SB_LUT4",
  125619. "parameters": {
  125620. "LUT_INIT": "1100001100111100"
  125621. },
  125622. "attributes": {
  125623. "module_not_derived": "00000000000000000000000000000001",
  125624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125625. },
  125626. "port_directions": {
  125627. "I0": "input",
  125628. "I1": "input",
  125629. "I2": "input",
  125630. "I3": "input",
  125631. "O": "output"
  125632. },
  125633. "connections": {
  125634. "I0": [ "0" ],
  125635. "I1": [ 5046 ],
  125636. "I2": [ 4975 ],
  125637. "I3": [ 5011 ],
  125638. "O": [ 5363 ]
  125639. }
  125640. },
  125641. "cpu_I.memory_MUL_LOW_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  125642. "hide_name": 0,
  125643. "type": "SB_CARRY",
  125644. "parameters": {
  125645. },
  125646. "attributes": {
  125647. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125648. },
  125649. "port_directions": {
  125650. "CI": "input",
  125651. "CO": "output",
  125652. "I0": "input",
  125653. "I1": "input"
  125654. },
  125655. "connections": {
  125656. "CI": [ 5361 ],
  125657. "CO": [ 5365 ],
  125658. "I0": [ 5359 ],
  125659. "I1": [ 5360 ]
  125660. }
  125661. },
  125662. "cpu_I.memory_MUL_LOW_SB_LUT4_O_7": {
  125663. "hide_name": 0,
  125664. "type": "SB_LUT4",
  125665. "parameters": {
  125666. "LUT_INIT": "0110100110010110"
  125667. },
  125668. "attributes": {
  125669. "module_not_derived": "00000000000000000000000000000001",
  125670. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125671. },
  125672. "port_directions": {
  125673. "I0": "input",
  125674. "I1": "input",
  125675. "I2": "input",
  125676. "I3": "input",
  125677. "O": "output"
  125678. },
  125679. "connections": {
  125680. "I0": [ "0" ],
  125681. "I1": [ 5367 ],
  125682. "I2": [ 5368 ],
  125683. "I3": [ 5369 ],
  125684. "O": [ 5370 ]
  125685. }
  125686. },
  125687. "cpu_I.memory_MUL_LOW_SB_LUT4_O_7_I1_SB_LUT4_O": {
  125688. "hide_name": 0,
  125689. "type": "SB_LUT4",
  125690. "parameters": {
  125691. "LUT_INIT": "1111110011000000"
  125692. },
  125693. "attributes": {
  125694. "module_not_derived": "00000000000000000000000000000001",
  125695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125696. },
  125697. "port_directions": {
  125698. "I0": "input",
  125699. "I1": "input",
  125700. "I2": "input",
  125701. "I3": "input",
  125702. "O": "output"
  125703. },
  125704. "connections": {
  125705. "I0": [ "0" ],
  125706. "I1": [ 5046 ],
  125707. "I2": [ 4975 ],
  125708. "I3": [ 5011 ],
  125709. "O": [ 5368 ]
  125710. }
  125711. },
  125712. "cpu_I.memory_MUL_LOW_SB_LUT4_O_7_I1_SB_LUT4_O_1": {
  125713. "hide_name": 0,
  125714. "type": "SB_LUT4",
  125715. "parameters": {
  125716. "LUT_INIT": "1100001100111100"
  125717. },
  125718. "attributes": {
  125719. "module_not_derived": "00000000000000000000000000000001",
  125720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125721. },
  125722. "port_directions": {
  125723. "I0": "input",
  125724. "I1": "input",
  125725. "I2": "input",
  125726. "I3": "input",
  125727. "O": "output"
  125728. },
  125729. "connections": {
  125730. "I0": [ "0" ],
  125731. "I1": [ 5047 ],
  125732. "I2": [ 5012 ],
  125733. "I3": [ 4976 ],
  125734. "O": [ 5367 ]
  125735. }
  125736. },
  125737. "cpu_I.memory_MUL_LOW_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  125738. "hide_name": 0,
  125739. "type": "SB_CARRY",
  125740. "parameters": {
  125741. },
  125742. "attributes": {
  125743. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125744. },
  125745. "port_directions": {
  125746. "CI": "input",
  125747. "CO": "output",
  125748. "I0": "input",
  125749. "I1": "input"
  125750. },
  125751. "connections": {
  125752. "CI": [ 5365 ],
  125753. "CO": [ 5369 ],
  125754. "I0": [ 5363 ],
  125755. "I1": [ 5364 ]
  125756. }
  125757. },
  125758. "cpu_I.memory_MUL_LOW_SB_LUT4_O_8": {
  125759. "hide_name": 0,
  125760. "type": "SB_LUT4",
  125761. "parameters": {
  125762. "LUT_INIT": "0110100110010110"
  125763. },
  125764. "attributes": {
  125765. "module_not_derived": "00000000000000000000000000000001",
  125766. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125767. },
  125768. "port_directions": {
  125769. "I0": "input",
  125770. "I1": "input",
  125771. "I2": "input",
  125772. "I3": "input",
  125773. "O": "output"
  125774. },
  125775. "connections": {
  125776. "I0": [ "0" ],
  125777. "I1": [ 5371 ],
  125778. "I2": [ 5372 ],
  125779. "I3": [ 5373 ],
  125780. "O": [ 5374 ]
  125781. }
  125782. },
  125783. "cpu_I.memory_MUL_LOW_SB_LUT4_O_8_I1_SB_LUT4_O": {
  125784. "hide_name": 0,
  125785. "type": "SB_LUT4",
  125786. "parameters": {
  125787. "LUT_INIT": "1111110011000000"
  125788. },
  125789. "attributes": {
  125790. "module_not_derived": "00000000000000000000000000000001",
  125791. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125792. },
  125793. "port_directions": {
  125794. "I0": "input",
  125795. "I1": "input",
  125796. "I2": "input",
  125797. "I3": "input",
  125798. "O": "output"
  125799. },
  125800. "connections": {
  125801. "I0": [ "0" ],
  125802. "I1": [ 5047 ],
  125803. "I2": [ 5012 ],
  125804. "I3": [ 4976 ],
  125805. "O": [ 5372 ]
  125806. }
  125807. },
  125808. "cpu_I.memory_MUL_LOW_SB_LUT4_O_8_I1_SB_LUT4_O_1": {
  125809. "hide_name": 0,
  125810. "type": "SB_LUT4",
  125811. "parameters": {
  125812. "LUT_INIT": "1100001100111100"
  125813. },
  125814. "attributes": {
  125815. "module_not_derived": "00000000000000000000000000000001",
  125816. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125817. },
  125818. "port_directions": {
  125819. "I0": "input",
  125820. "I1": "input",
  125821. "I2": "input",
  125822. "I3": "input",
  125823. "O": "output"
  125824. },
  125825. "connections": {
  125826. "I0": [ "0" ],
  125827. "I1": [ 5048 ],
  125828. "I2": [ 5013 ],
  125829. "I3": [ 4977 ],
  125830. "O": [ 5371 ]
  125831. }
  125832. },
  125833. "cpu_I.memory_MUL_LOW_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  125834. "hide_name": 0,
  125835. "type": "SB_CARRY",
  125836. "parameters": {
  125837. },
  125838. "attributes": {
  125839. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125840. },
  125841. "port_directions": {
  125842. "CI": "input",
  125843. "CO": "output",
  125844. "I0": "input",
  125845. "I1": "input"
  125846. },
  125847. "connections": {
  125848. "CI": [ 5369 ],
  125849. "CO": [ 5373 ],
  125850. "I0": [ 5367 ],
  125851. "I1": [ 5368 ]
  125852. }
  125853. },
  125854. "cpu_I.memory_MUL_LOW_SB_LUT4_O_9": {
  125855. "hide_name": 0,
  125856. "type": "SB_LUT4",
  125857. "parameters": {
  125858. "LUT_INIT": "0110100110010110"
  125859. },
  125860. "attributes": {
  125861. "module_not_derived": "00000000000000000000000000000001",
  125862. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  125863. },
  125864. "port_directions": {
  125865. "I0": "input",
  125866. "I1": "input",
  125867. "I2": "input",
  125868. "I3": "input",
  125869. "O": "output"
  125870. },
  125871. "connections": {
  125872. "I0": [ "0" ],
  125873. "I1": [ 5254 ],
  125874. "I2": [ 5255 ],
  125875. "I3": [ 5253 ],
  125876. "O": [ 5375 ]
  125877. }
  125878. },
  125879. "cpu_I.memory_MUL_LOW_SB_LUT4_O_9_I1_SB_LUT4_O": {
  125880. "hide_name": 0,
  125881. "type": "SB_LUT4",
  125882. "parameters": {
  125883. "LUT_INIT": "1111110011000000"
  125884. },
  125885. "attributes": {
  125886. "module_not_derived": "00000000000000000000000000000001",
  125887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125888. },
  125889. "port_directions": {
  125890. "I0": "input",
  125891. "I1": "input",
  125892. "I2": "input",
  125893. "I3": "input",
  125894. "O": "output"
  125895. },
  125896. "connections": {
  125897. "I0": [ "0" ],
  125898. "I1": [ 5048 ],
  125899. "I2": [ 5013 ],
  125900. "I3": [ 4977 ],
  125901. "O": [ 5255 ]
  125902. }
  125903. },
  125904. "cpu_I.memory_MUL_LOW_SB_LUT4_O_9_I1_SB_LUT4_O_1": {
  125905. "hide_name": 0,
  125906. "type": "SB_LUT4",
  125907. "parameters": {
  125908. "LUT_INIT": "1100001100111100"
  125909. },
  125910. "attributes": {
  125911. "module_not_derived": "00000000000000000000000000000001",
  125912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  125913. },
  125914. "port_directions": {
  125915. "I0": "input",
  125916. "I1": "input",
  125917. "I2": "input",
  125918. "I3": "input",
  125919. "O": "output"
  125920. },
  125921. "connections": {
  125922. "I0": [ "0" ],
  125923. "I1": [ 5049 ],
  125924. "I2": [ 5014 ],
  125925. "I3": [ 4978 ],
  125926. "O": [ 5254 ]
  125927. }
  125928. },
  125929. "cpu_I.memory_MUL_LOW_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  125930. "hide_name": 0,
  125931. "type": "SB_CARRY",
  125932. "parameters": {
  125933. },
  125934. "attributes": {
  125935. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  125936. },
  125937. "port_directions": {
  125938. "CI": "input",
  125939. "CO": "output",
  125940. "I0": "input",
  125941. "I1": "input"
  125942. },
  125943. "connections": {
  125944. "CI": [ 5373 ],
  125945. "CO": [ 5253 ],
  125946. "I0": [ 5371 ],
  125947. "I1": [ 5372 ]
  125948. }
  125949. },
  125950. "cpu_I.memory_MUL_LOW_SB_LUT4_O_I1_SB_LUT4_O": {
  125951. "hide_name": 0,
  125952. "type": "SB_LUT4",
  125953. "parameters": {
  125954. "LUT_INIT": "0000111111110000"
  125955. },
  125956. "attributes": {
  125957. "module_not_derived": "00000000000000000000000000000001",
  125958. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125959. },
  125960. "port_directions": {
  125961. "I0": "input",
  125962. "I1": "input",
  125963. "I2": "input",
  125964. "I3": "input",
  125965. "O": "output"
  125966. },
  125967. "connections": {
  125968. "I0": [ "0" ],
  125969. "I1": [ "0" ],
  125970. "I2": [ 4993 ],
  125971. "I3": [ 4957 ],
  125972. "O": [ 5242 ]
  125973. }
  125974. },
  125975. "cpu_I.memory_MUL_LOW_SB_LUT4_O_I1_SB_LUT4_O_1": {
  125976. "hide_name": 0,
  125977. "type": "SB_LUT4",
  125978. "parameters": {
  125979. "LUT_INIT": "1111000000000000"
  125980. },
  125981. "attributes": {
  125982. "module_not_derived": "00000000000000000000000000000001",
  125983. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  125984. },
  125985. "port_directions": {
  125986. "I0": "input",
  125987. "I1": "input",
  125988. "I2": "input",
  125989. "I3": "input",
  125990. "O": "output"
  125991. },
  125992. "connections": {
  125993. "I0": [ "0" ],
  125994. "I1": [ "0" ],
  125995. "I2": [ 4958 ],
  125996. "I3": [ 4994 ],
  125997. "O": [ 5243 ]
  125998. }
  125999. },
  126000. "cpu_I.memory_MUL_LOW_SB_LUT4_O_I3_SB_CARRY_CO": {
  126001. "hide_name": 0,
  126002. "type": "SB_CARRY",
  126003. "parameters": {
  126004. },
  126005. "attributes": {
  126006. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  126007. },
  126008. "port_directions": {
  126009. "CI": "input",
  126010. "CO": "output",
  126011. "I0": "input",
  126012. "I1": "input"
  126013. },
  126014. "connections": {
  126015. "CI": [ 5286 ],
  126016. "CO": [ 5244 ],
  126017. "I0": [ 5284 ],
  126018. "I1": [ 5285 ]
  126019. }
  126020. },
  126021. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_DFF_Q": {
  126022. "hide_name": 0,
  126023. "type": "SB_DFF",
  126024. "parameters": {
  126025. },
  126026. "attributes": {
  126027. "module_not_derived": "00000000000000000000000000000001",
  126028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126029. },
  126030. "port_directions": {
  126031. "C": "input",
  126032. "D": "input",
  126033. "Q": "output"
  126034. },
  126035. "connections": {
  126036. "C": [ 42 ],
  126037. "D": [ 4906 ],
  126038. "Q": [ 5376 ]
  126039. }
  126040. },
  126041. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_DFF_Q_1": {
  126042. "hide_name": 0,
  126043. "type": "SB_DFF",
  126044. "parameters": {
  126045. },
  126046. "attributes": {
  126047. "module_not_derived": "00000000000000000000000000000001",
  126048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126049. },
  126050. "port_directions": {
  126051. "C": "input",
  126052. "D": "input",
  126053. "Q": "output"
  126054. },
  126055. "connections": {
  126056. "C": [ 42 ],
  126057. "D": [ 4907 ],
  126058. "Q": [ 5377 ]
  126059. }
  126060. },
  126061. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1": {
  126062. "hide_name": 0,
  126063. "type": "SB_LUT4",
  126064. "parameters": {
  126065. "LUT_INIT": "0011000000000000"
  126066. },
  126067. "attributes": {
  126068. "module_not_derived": "00000000000000000000000000000001",
  126069. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  126070. },
  126071. "port_directions": {
  126072. "I0": "input",
  126073. "I1": "input",
  126074. "I2": "input",
  126075. "I3": "input",
  126076. "O": "output"
  126077. },
  126078. "connections": {
  126079. "I0": [ "0" ],
  126080. "I1": [ 5376 ],
  126081. "I2": [ 5377 ],
  126082. "I3": [ 2326 ],
  126083. "O": [ 4449 ]
  126084. }
  126085. },
  126086. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_I0": {
  126087. "hide_name": 0,
  126088. "type": "SB_LUT4",
  126089. "parameters": {
  126090. "LUT_INIT": "0001001100000000"
  126091. },
  126092. "attributes": {
  126093. "module_not_derived": "00000000000000000000000000000001",
  126094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  126095. },
  126096. "port_directions": {
  126097. "I0": "input",
  126098. "I1": "input",
  126099. "I2": "input",
  126100. "I3": "input",
  126101. "O": "output"
  126102. },
  126103. "connections": {
  126104. "I0": [ 1154 ],
  126105. "I1": [ 4449 ],
  126106. "I2": [ 1365 ],
  126107. "I3": [ 5378 ],
  126108. "O": [ 5379 ]
  126109. }
  126110. },
  126111. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_I0_O_SB_LUT4_I1": {
  126112. "hide_name": 0,
  126113. "type": "SB_LUT4",
  126114. "parameters": {
  126115. "LUT_INIT": "0000000000001100"
  126116. },
  126117. "attributes": {
  126118. "module_not_derived": "00000000000000000000000000000001",
  126119. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  126120. },
  126121. "port_directions": {
  126122. "I0": "input",
  126123. "I1": "input",
  126124. "I2": "input",
  126125. "I3": "input",
  126126. "O": "output"
  126127. },
  126128. "connections": {
  126129. "I0": [ "0" ],
  126130. "I1": [ 5379 ],
  126131. "I2": [ 5380 ],
  126132. "I3": [ 1020 ],
  126133. "O": [ 1475 ]
  126134. }
  126135. },
  126136. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_I0_O_SB_LUT4_O": {
  126137. "hide_name": 0,
  126138. "type": "SB_LUT4",
  126139. "parameters": {
  126140. "LUT_INIT": "1010101000000010"
  126141. },
  126142. "attributes": {
  126143. "module_not_derived": "00000000000000000000000000000001",
  126144. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  126145. },
  126146. "port_directions": {
  126147. "I0": "input",
  126148. "I1": "input",
  126149. "I2": "input",
  126150. "I3": "input",
  126151. "O": "output"
  126152. },
  126153. "connections": {
  126154. "I0": [ 1365 ],
  126155. "I1": [ 3277 ],
  126156. "I2": [ 3284 ],
  126157. "I3": [ 3279 ],
  126158. "O": [ 5380 ]
  126159. }
  126160. },
  126161. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_O": {
  126162. "hide_name": 0,
  126163. "type": "SB_LUT4",
  126164. "parameters": {
  126165. "LUT_INIT": "0000000010111111"
  126166. },
  126167. "attributes": {
  126168. "module_not_derived": "00000000000000000000000000000001",
  126169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  126170. },
  126171. "port_directions": {
  126172. "I0": "input",
  126173. "I1": "input",
  126174. "I2": "input",
  126175. "I3": "input",
  126176. "O": "output"
  126177. },
  126178. "connections": {
  126179. "I0": [ 1239 ],
  126180. "I1": [ 1240 ],
  126181. "I2": [ 1241 ],
  126182. "I3": [ 5381 ],
  126183. "O": [ 5378 ]
  126184. }
  126185. },
  126186. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_O_I3_SB_LUT4_O": {
  126187. "hide_name": 0,
  126188. "type": "SB_LUT4",
  126189. "parameters": {
  126190. "LUT_INIT": "0011000000000000"
  126191. },
  126192. "attributes": {
  126193. "module_not_derived": "00000000000000000000000000000001",
  126194. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  126195. },
  126196. "port_directions": {
  126197. "I0": "input",
  126198. "I1": "input",
  126199. "I2": "input",
  126200. "I3": "input",
  126201. "O": "output"
  126202. },
  126203. "connections": {
  126204. "I0": [ "0" ],
  126205. "I1": [ 4906 ],
  126206. "I2": [ 4907 ],
  126207. "I3": [ 3090 ],
  126208. "O": [ 5381 ]
  126209. }
  126210. },
  126211. "cpu_I.memory_to_writeBack_INSTRUCTION_SB_DFFR_Q": {
  126212. "hide_name": 0,
  126213. "type": "SB_DFFR",
  126214. "parameters": {
  126215. },
  126216. "attributes": {
  126217. "module_not_derived": "00000000000000000000000000000001",
  126218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  126219. },
  126220. "port_directions": {
  126221. "C": "input",
  126222. "D": "input",
  126223. "Q": "output",
  126224. "R": "input"
  126225. },
  126226. "connections": {
  126227. "C": [ 42 ],
  126228. "D": [ 4901 ],
  126229. "Q": [ 2264 ],
  126230. "R": [ 127 ]
  126231. }
  126232. },
  126233. "cpu_I.memory_to_writeBack_INSTRUCTION_SB_DFFR_Q_1": {
  126234. "hide_name": 0,
  126235. "type": "SB_DFFR",
  126236. "parameters": {
  126237. },
  126238. "attributes": {
  126239. "module_not_derived": "00000000000000000000000000000001",
  126240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  126241. },
  126242. "port_directions": {
  126243. "C": "input",
  126244. "D": "input",
  126245. "Q": "output",
  126246. "R": "input"
  126247. },
  126248. "connections": {
  126249. "C": [ 42 ],
  126250. "D": [ 4902 ],
  126251. "Q": [ 2265 ],
  126252. "R": [ 127 ]
  126253. }
  126254. },
  126255. "cpu_I.memory_to_writeBack_INSTRUCTION_SB_DFFR_Q_2": {
  126256. "hide_name": 0,
  126257. "type": "SB_DFFR",
  126258. "parameters": {
  126259. },
  126260. "attributes": {
  126261. "module_not_derived": "00000000000000000000000000000001",
  126262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  126263. },
  126264. "port_directions": {
  126265. "C": "input",
  126266. "D": "input",
  126267. "Q": "output",
  126268. "R": "input"
  126269. },
  126270. "connections": {
  126271. "C": [ 42 ],
  126272. "D": [ 4899 ],
  126273. "Q": [ 2266 ],
  126274. "R": [ 127 ]
  126275. }
  126276. },
  126277. "cpu_I.memory_to_writeBack_INSTRUCTION_SB_DFFR_Q_3": {
  126278. "hide_name": 0,
  126279. "type": "SB_DFFR",
  126280. "parameters": {
  126281. },
  126282. "attributes": {
  126283. "module_not_derived": "00000000000000000000000000000001",
  126284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  126285. },
  126286. "port_directions": {
  126287. "C": "input",
  126288. "D": "input",
  126289. "Q": "output",
  126290. "R": "input"
  126291. },
  126292. "connections": {
  126293. "C": [ 42 ],
  126294. "D": [ 4896 ],
  126295. "Q": [ 2267 ],
  126296. "R": [ 127 ]
  126297. }
  126298. },
  126299. "cpu_I.memory_to_writeBack_INSTRUCTION_SB_DFFR_Q_4": {
  126300. "hide_name": 0,
  126301. "type": "SB_DFFR",
  126302. "parameters": {
  126303. },
  126304. "attributes": {
  126305. "module_not_derived": "00000000000000000000000000000001",
  126306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  126307. },
  126308. "port_directions": {
  126309. "C": "input",
  126310. "D": "input",
  126311. "Q": "output",
  126312. "R": "input"
  126313. },
  126314. "connections": {
  126315. "C": [ 42 ],
  126316. "D": [ 4900 ],
  126317. "Q": [ 2268 ],
  126318. "R": [ 127 ]
  126319. }
  126320. },
  126321. "cpu_I.memory_to_writeBack_IS_MUL_SB_DFF_Q": {
  126322. "hide_name": 0,
  126323. "type": "SB_DFF",
  126324. "parameters": {
  126325. },
  126326. "attributes": {
  126327. "module_not_derived": "00000000000000000000000000000001",
  126328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126329. },
  126330. "port_directions": {
  126331. "C": "input",
  126332. "D": "input",
  126333. "Q": "output"
  126334. },
  126335. "connections": {
  126336. "C": [ 42 ],
  126337. "D": [ 4909 ],
  126338. "Q": [ 5382 ]
  126339. }
  126340. },
  126341. "cpu_I.memory_to_writeBack_IS_MUL_SB_LUT4_I2": {
  126342. "hide_name": 0,
  126343. "type": "SB_LUT4",
  126344. "parameters": {
  126345. "LUT_INIT": "1111000000000000"
  126346. },
  126347. "attributes": {
  126348. "module_not_derived": "00000000000000000000000000000001",
  126349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  126350. },
  126351. "port_directions": {
  126352. "I0": "input",
  126353. "I1": "input",
  126354. "I2": "input",
  126355. "I3": "input",
  126356. "O": "output"
  126357. },
  126358. "connections": {
  126359. "I0": [ "0" ],
  126360. "I1": [ "0" ],
  126361. "I2": [ 5382 ],
  126362. "I3": [ 2326 ],
  126363. "O": [ 3296 ]
  126364. }
  126365. },
  126366. "cpu_I.memory_to_writeBack_IS_MUL_SB_LUT4_I2_O_SB_DFFR_Q": {
  126367. "hide_name": 0,
  126368. "type": "SB_DFFR",
  126369. "parameters": {
  126370. },
  126371. "attributes": {
  126372. "module_not_derived": "00000000000000000000000000000001",
  126373. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  126374. },
  126375. "port_directions": {
  126376. "C": "input",
  126377. "D": "input",
  126378. "Q": "output",
  126379. "R": "input"
  126380. },
  126381. "connections": {
  126382. "C": [ 42 ],
  126383. "D": [ 3153 ],
  126384. "Q": [ 3400 ],
  126385. "R": [ 127 ]
  126386. }
  126387. },
  126388. "cpu_I.memory_to_writeBack_MEMORY_ADDRESS_LOW_SB_DFF_Q": {
  126389. "hide_name": 0,
  126390. "type": "SB_DFF",
  126391. "parameters": {
  126392. },
  126393. "attributes": {
  126394. "module_not_derived": "00000000000000000000000000000001",
  126395. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126396. },
  126397. "port_directions": {
  126398. "C": "input",
  126399. "D": "input",
  126400. "Q": "output"
  126401. },
  126402. "connections": {
  126403. "C": [ 42 ],
  126404. "D": [ 4910 ],
  126405. "Q": [ 3385 ]
  126406. }
  126407. },
  126408. "cpu_I.memory_to_writeBack_MEMORY_ADDRESS_LOW_SB_DFF_Q_1": {
  126409. "hide_name": 0,
  126410. "type": "SB_DFF",
  126411. "parameters": {
  126412. },
  126413. "attributes": {
  126414. "module_not_derived": "00000000000000000000000000000001",
  126415. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126416. },
  126417. "port_directions": {
  126418. "C": "input",
  126419. "D": "input",
  126420. "Q": "output"
  126421. },
  126422. "connections": {
  126423. "C": [ 42 ],
  126424. "D": [ 4911 ],
  126425. "Q": [ 3386 ]
  126426. }
  126427. },
  126428. "cpu_I.memory_to_writeBack_MEMORY_ENABLE_SB_DFF_Q": {
  126429. "hide_name": 0,
  126430. "type": "SB_DFF",
  126431. "parameters": {
  126432. },
  126433. "attributes": {
  126434. "module_not_derived": "00000000000000000000000000000001",
  126435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126436. },
  126437. "port_directions": {
  126438. "C": "input",
  126439. "D": "input",
  126440. "Q": "output"
  126441. },
  126442. "connections": {
  126443. "C": [ 42 ],
  126444. "D": [ 4912 ],
  126445. "Q": [ 5383 ]
  126446. }
  126447. },
  126448. "cpu_I.memory_to_writeBack_MEMORY_ENABLE_SB_LUT4_I2": {
  126449. "hide_name": 0,
  126450. "type": "SB_LUT4",
  126451. "parameters": {
  126452. "LUT_INIT": "1111000000000000"
  126453. },
  126454. "attributes": {
  126455. "module_not_derived": "00000000000000000000000000000001",
  126456. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  126457. },
  126458. "port_directions": {
  126459. "I0": "input",
  126460. "I1": "input",
  126461. "I2": "input",
  126462. "I3": "input",
  126463. "O": "output"
  126464. },
  126465. "connections": {
  126466. "I0": [ "0" ],
  126467. "I1": [ "0" ],
  126468. "I2": [ 5383 ],
  126469. "I3": [ 2326 ],
  126470. "O": [ 3316 ]
  126471. }
  126472. },
  126473. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q": {
  126474. "hide_name": 0,
  126475. "type": "SB_DFF",
  126476. "parameters": {
  126477. },
  126478. "attributes": {
  126479. "module_not_derived": "00000000000000000000000000000001",
  126480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126481. },
  126482. "port_directions": {
  126483. "C": "input",
  126484. "D": "input",
  126485. "Q": "output"
  126486. },
  126487. "connections": {
  126488. "C": [ 42 ],
  126489. "D": [ 834 ],
  126490. "Q": [ 3363 ]
  126491. }
  126492. },
  126493. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_1": {
  126494. "hide_name": 0,
  126495. "type": "SB_DFF",
  126496. "parameters": {
  126497. },
  126498. "attributes": {
  126499. "module_not_derived": "00000000000000000000000000000001",
  126500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126501. },
  126502. "port_directions": {
  126503. "C": "input",
  126504. "D": "input",
  126505. "Q": "output"
  126506. },
  126507. "connections": {
  126508. "C": [ 42 ],
  126509. "D": [ 837 ],
  126510. "Q": [ 3354 ]
  126511. }
  126512. },
  126513. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_10": {
  126514. "hide_name": 0,
  126515. "type": "SB_DFF",
  126516. "parameters": {
  126517. },
  126518. "attributes": {
  126519. "module_not_derived": "00000000000000000000000000000001",
  126520. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126521. },
  126522. "port_directions": {
  126523. "C": "input",
  126524. "D": "input",
  126525. "Q": "output"
  126526. },
  126527. "connections": {
  126528. "C": [ 42 ],
  126529. "D": [ 777 ],
  126530. "Q": [ 3446 ]
  126531. }
  126532. },
  126533. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_11": {
  126534. "hide_name": 0,
  126535. "type": "SB_DFF",
  126536. "parameters": {
  126537. },
  126538. "attributes": {
  126539. "module_not_derived": "00000000000000000000000000000001",
  126540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126541. },
  126542. "port_directions": {
  126543. "C": "input",
  126544. "D": "input",
  126545. "Q": "output"
  126546. },
  126547. "connections": {
  126548. "C": [ 42 ],
  126549. "D": [ 780 ],
  126550. "Q": [ 3458 ]
  126551. }
  126552. },
  126553. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_12": {
  126554. "hide_name": 0,
  126555. "type": "SB_DFF",
  126556. "parameters": {
  126557. },
  126558. "attributes": {
  126559. "module_not_derived": "00000000000000000000000000000001",
  126560. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126561. },
  126562. "port_directions": {
  126563. "C": "input",
  126564. "D": "input",
  126565. "Q": "output"
  126566. },
  126567. "connections": {
  126568. "C": [ 42 ],
  126569. "D": [ 789 ],
  126570. "Q": [ 3471 ]
  126571. }
  126572. },
  126573. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_13": {
  126574. "hide_name": 0,
  126575. "type": "SB_DFF",
  126576. "parameters": {
  126577. },
  126578. "attributes": {
  126579. "module_not_derived": "00000000000000000000000000000001",
  126580. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126581. },
  126582. "port_directions": {
  126583. "C": "input",
  126584. "D": "input",
  126585. "Q": "output"
  126586. },
  126587. "connections": {
  126588. "C": [ 42 ],
  126589. "D": [ 792 ],
  126590. "Q": [ 3485 ]
  126591. }
  126592. },
  126593. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_14": {
  126594. "hide_name": 0,
  126595. "type": "SB_DFF",
  126596. "parameters": {
  126597. },
  126598. "attributes": {
  126599. "module_not_derived": "00000000000000000000000000000001",
  126600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126601. },
  126602. "port_directions": {
  126603. "C": "input",
  126604. "D": "input",
  126605. "Q": "output"
  126606. },
  126607. "connections": {
  126608. "C": [ 42 ],
  126609. "D": [ 795 ],
  126610. "Q": [ 3498 ]
  126611. }
  126612. },
  126613. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_15": {
  126614. "hide_name": 0,
  126615. "type": "SB_DFF",
  126616. "parameters": {
  126617. },
  126618. "attributes": {
  126619. "module_not_derived": "00000000000000000000000000000001",
  126620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126621. },
  126622. "port_directions": {
  126623. "C": "input",
  126624. "D": "input",
  126625. "Q": "output"
  126626. },
  126627. "connections": {
  126628. "C": [ 42 ],
  126629. "D": [ 798 ],
  126630. "Q": [ 3413 ]
  126631. }
  126632. },
  126633. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_16": {
  126634. "hide_name": 0,
  126635. "type": "SB_DFF",
  126636. "parameters": {
  126637. },
  126638. "attributes": {
  126639. "module_not_derived": "00000000000000000000000000000001",
  126640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126641. },
  126642. "port_directions": {
  126643. "C": "input",
  126644. "D": "input",
  126645. "Q": "output"
  126646. },
  126647. "connections": {
  126648. "C": [ 42 ],
  126649. "D": [ 801 ],
  126650. "Q": [ 3425 ]
  126651. }
  126652. },
  126653. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_17": {
  126654. "hide_name": 0,
  126655. "type": "SB_DFF",
  126656. "parameters": {
  126657. },
  126658. "attributes": {
  126659. "module_not_derived": "00000000000000000000000000000001",
  126660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126661. },
  126662. "port_directions": {
  126663. "C": "input",
  126664. "D": "input",
  126665. "Q": "output"
  126666. },
  126667. "connections": {
  126668. "C": [ 42 ],
  126669. "D": [ 804 ],
  126670. "Q": [ 3518 ]
  126671. }
  126672. },
  126673. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_18": {
  126674. "hide_name": 0,
  126675. "type": "SB_DFF",
  126676. "parameters": {
  126677. },
  126678. "attributes": {
  126679. "module_not_derived": "00000000000000000000000000000001",
  126680. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126681. },
  126682. "port_directions": {
  126683. "C": "input",
  126684. "D": "input",
  126685. "Q": "output"
  126686. },
  126687. "connections": {
  126688. "C": [ 42 ],
  126689. "D": [ 807 ],
  126690. "Q": [ 3444 ]
  126691. }
  126692. },
  126693. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_19": {
  126694. "hide_name": 0,
  126695. "type": "SB_DFF",
  126696. "parameters": {
  126697. },
  126698. "attributes": {
  126699. "module_not_derived": "00000000000000000000000000000001",
  126700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126701. },
  126702. "port_directions": {
  126703. "C": "input",
  126704. "D": "input",
  126705. "Q": "output"
  126706. },
  126707. "connections": {
  126708. "C": [ 42 ],
  126709. "D": [ 810 ],
  126710. "Q": [ 3457 ]
  126711. }
  126712. },
  126713. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_2": {
  126714. "hide_name": 0,
  126715. "type": "SB_DFF",
  126716. "parameters": {
  126717. },
  126718. "attributes": {
  126719. "module_not_derived": "00000000000000000000000000000001",
  126720. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126721. },
  126722. "port_directions": {
  126723. "C": "input",
  126724. "D": "input",
  126725. "Q": "output"
  126726. },
  126727. "connections": {
  126728. "C": [ 42 ],
  126729. "D": [ 753 ],
  126730. "Q": [ 3345 ]
  126731. }
  126732. },
  126733. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_20": {
  126734. "hide_name": 0,
  126735. "type": "SB_DFF",
  126736. "parameters": {
  126737. },
  126738. "attributes": {
  126739. "module_not_derived": "00000000000000000000000000000001",
  126740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126741. },
  126742. "port_directions": {
  126743. "C": "input",
  126744. "D": "input",
  126745. "Q": "output"
  126746. },
  126747. "connections": {
  126748. "C": [ 42 ],
  126749. "D": [ 813 ],
  126750. "Q": [ 3470 ]
  126751. }
  126752. },
  126753. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_21": {
  126754. "hide_name": 0,
  126755. "type": "SB_DFF",
  126756. "parameters": {
  126757. },
  126758. "attributes": {
  126759. "module_not_derived": "00000000000000000000000000000001",
  126760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126761. },
  126762. "port_directions": {
  126763. "C": "input",
  126764. "D": "input",
  126765. "Q": "output"
  126766. },
  126767. "connections": {
  126768. "C": [ 42 ],
  126769. "D": [ 819 ],
  126770. "Q": [ 3486 ]
  126771. }
  126772. },
  126773. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_22": {
  126774. "hide_name": 0,
  126775. "type": "SB_DFF",
  126776. "parameters": {
  126777. },
  126778. "attributes": {
  126779. "module_not_derived": "00000000000000000000000000000001",
  126780. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126781. },
  126782. "port_directions": {
  126783. "C": "input",
  126784. "D": "input",
  126785. "Q": "output"
  126786. },
  126787. "connections": {
  126788. "C": [ 42 ],
  126789. "D": [ 747 ],
  126790. "Q": [ 3384 ]
  126791. }
  126792. },
  126793. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_23": {
  126794. "hide_name": 0,
  126795. "type": "SB_DFF",
  126796. "parameters": {
  126797. },
  126798. "attributes": {
  126799. "module_not_derived": "00000000000000000000000000000001",
  126800. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126801. },
  126802. "port_directions": {
  126803. "C": "input",
  126804. "D": "input",
  126805. "Q": "output"
  126806. },
  126807. "connections": {
  126808. "C": [ 42 ],
  126809. "D": [ 750 ],
  126810. "Q": [ 3398 ]
  126811. }
  126812. },
  126813. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_24": {
  126814. "hide_name": 0,
  126815. "type": "SB_DFF",
  126816. "parameters": {
  126817. },
  126818. "attributes": {
  126819. "module_not_derived": "00000000000000000000000000000001",
  126820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126821. },
  126822. "port_directions": {
  126823. "C": "input",
  126824. "D": "input",
  126825. "Q": "output"
  126826. },
  126827. "connections": {
  126828. "C": [ 42 ],
  126829. "D": [ 783 ],
  126830. "Q": [ 3635 ]
  126831. }
  126832. },
  126833. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_25": {
  126834. "hide_name": 0,
  126835. "type": "SB_DFF",
  126836. "parameters": {
  126837. },
  126838. "attributes": {
  126839. "module_not_derived": "00000000000000000000000000000001",
  126840. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126841. },
  126842. "port_directions": {
  126843. "C": "input",
  126844. "D": "input",
  126845. "Q": "output"
  126846. },
  126847. "connections": {
  126848. "C": [ 42 ],
  126849. "D": [ 816 ],
  126850. "Q": [ 3633 ]
  126851. }
  126852. },
  126853. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_26": {
  126854. "hide_name": 0,
  126855. "type": "SB_DFF",
  126856. "parameters": {
  126857. },
  126858. "attributes": {
  126859. "module_not_derived": "00000000000000000000000000000001",
  126860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126861. },
  126862. "port_directions": {
  126863. "C": "input",
  126864. "D": "input",
  126865. "Q": "output"
  126866. },
  126867. "connections": {
  126868. "C": [ 42 ],
  126869. "D": [ 825 ],
  126870. "Q": [ 3441 ]
  126871. }
  126872. },
  126873. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_27": {
  126874. "hide_name": 0,
  126875. "type": "SB_DFF",
  126876. "parameters": {
  126877. },
  126878. "attributes": {
  126879. "module_not_derived": "00000000000000000000000000000001",
  126880. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126881. },
  126882. "port_directions": {
  126883. "C": "input",
  126884. "D": "input",
  126885. "Q": "output"
  126886. },
  126887. "connections": {
  126888. "C": [ 42 ],
  126889. "D": [ 828 ],
  126890. "Q": [ 3459 ]
  126891. }
  126892. },
  126893. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_28": {
  126894. "hide_name": 0,
  126895. "type": "SB_DFF",
  126896. "parameters": {
  126897. },
  126898. "attributes": {
  126899. "module_not_derived": "00000000000000000000000000000001",
  126900. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126901. },
  126902. "port_directions": {
  126903. "C": "input",
  126904. "D": "input",
  126905. "Q": "output"
  126906. },
  126907. "connections": {
  126908. "C": [ 42 ],
  126909. "D": [ 831 ],
  126910. "Q": [ 3472 ]
  126911. }
  126912. },
  126913. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_29": {
  126914. "hide_name": 0,
  126915. "type": "SB_DFF",
  126916. "parameters": {
  126917. },
  126918. "attributes": {
  126919. "module_not_derived": "00000000000000000000000000000001",
  126920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126921. },
  126922. "port_directions": {
  126923. "C": "input",
  126924. "D": "input",
  126925. "Q": "output"
  126926. },
  126927. "connections": {
  126928. "C": [ 42 ],
  126929. "D": [ 840 ],
  126930. "Q": [ 3482 ]
  126931. }
  126932. },
  126933. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_3": {
  126934. "hide_name": 0,
  126935. "type": "SB_DFF",
  126936. "parameters": {
  126937. },
  126938. "attributes": {
  126939. "module_not_derived": "00000000000000000000000000000001",
  126940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126941. },
  126942. "port_directions": {
  126943. "C": "input",
  126944. "D": "input",
  126945. "Q": "output"
  126946. },
  126947. "connections": {
  126948. "C": [ 42 ],
  126949. "D": [ 756 ],
  126950. "Q": [ 3336 ]
  126951. }
  126952. },
  126953. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_30": {
  126954. "hide_name": 0,
  126955. "type": "SB_DFF",
  126956. "parameters": {
  126957. },
  126958. "attributes": {
  126959. "module_not_derived": "00000000000000000000000000000001",
  126960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126961. },
  126962. "port_directions": {
  126963. "C": "input",
  126964. "D": "input",
  126965. "Q": "output"
  126966. },
  126967. "connections": {
  126968. "C": [ 42 ],
  126969. "D": [ 786 ],
  126970. "Q": [ 3495 ]
  126971. }
  126972. },
  126973. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_31": {
  126974. "hide_name": 0,
  126975. "type": "SB_DFF",
  126976. "parameters": {
  126977. },
  126978. "attributes": {
  126979. "module_not_derived": "00000000000000000000000000000001",
  126980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  126981. },
  126982. "port_directions": {
  126983. "C": "input",
  126984. "D": "input",
  126985. "Q": "output"
  126986. },
  126987. "connections": {
  126988. "C": [ 42 ],
  126989. "D": [ 822 ],
  126990. "Q": [ 3571 ]
  126991. }
  126992. },
  126993. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_4": {
  126994. "hide_name": 0,
  126995. "type": "SB_DFF",
  126996. "parameters": {
  126997. },
  126998. "attributes": {
  126999. "module_not_derived": "00000000000000000000000000000001",
  127000. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127001. },
  127002. "port_directions": {
  127003. "C": "input",
  127004. "D": "input",
  127005. "Q": "output"
  127006. },
  127007. "connections": {
  127008. "C": [ 42 ],
  127009. "D": [ 759 ],
  127010. "Q": [ 3327 ]
  127011. }
  127012. },
  127013. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_5": {
  127014. "hide_name": 0,
  127015. "type": "SB_DFF",
  127016. "parameters": {
  127017. },
  127018. "attributes": {
  127019. "module_not_derived": "00000000000000000000000000000001",
  127020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127021. },
  127022. "port_directions": {
  127023. "C": "input",
  127024. "D": "input",
  127025. "Q": "output"
  127026. },
  127027. "connections": {
  127028. "C": [ 42 ],
  127029. "D": [ 762 ],
  127030. "Q": [ 3319 ]
  127031. }
  127032. },
  127033. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_6": {
  127034. "hide_name": 0,
  127035. "type": "SB_DFF",
  127036. "parameters": {
  127037. },
  127038. "attributes": {
  127039. "module_not_derived": "00000000000000000000000000000001",
  127040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127041. },
  127042. "port_directions": {
  127043. "C": "input",
  127044. "D": "input",
  127045. "Q": "output"
  127046. },
  127047. "connections": {
  127048. "C": [ 42 ],
  127049. "D": [ 765 ],
  127050. "Q": [ 3303 ]
  127051. }
  127052. },
  127053. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_7": {
  127054. "hide_name": 0,
  127055. "type": "SB_DFF",
  127056. "parameters": {
  127057. },
  127058. "attributes": {
  127059. "module_not_derived": "00000000000000000000000000000001",
  127060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127061. },
  127062. "port_directions": {
  127063. "C": "input",
  127064. "D": "input",
  127065. "Q": "output"
  127066. },
  127067. "connections": {
  127068. "C": [ 42 ],
  127069. "D": [ 768 ],
  127070. "Q": [ 3397 ]
  127071. }
  127072. },
  127073. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_8": {
  127074. "hide_name": 0,
  127075. "type": "SB_DFF",
  127076. "parameters": {
  127077. },
  127078. "attributes": {
  127079. "module_not_derived": "00000000000000000000000000000001",
  127080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127081. },
  127082. "port_directions": {
  127083. "C": "input",
  127084. "D": "input",
  127085. "Q": "output"
  127086. },
  127087. "connections": {
  127088. "C": [ 42 ],
  127089. "D": [ 771 ],
  127090. "Q": [ 3616 ]
  127091. }
  127092. },
  127093. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA_SB_DFF_Q_9": {
  127094. "hide_name": 0,
  127095. "type": "SB_DFF",
  127096. "parameters": {
  127097. },
  127098. "attributes": {
  127099. "module_not_derived": "00000000000000000000000000000001",
  127100. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127101. },
  127102. "port_directions": {
  127103. "C": "input",
  127104. "D": "input",
  127105. "Q": "output"
  127106. },
  127107. "connections": {
  127108. "C": [ 42 ],
  127109. "D": [ 774 ],
  127110. "Q": [ 3607 ]
  127111. }
  127112. },
  127113. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q": {
  127114. "hide_name": 0,
  127115. "type": "SB_DFF",
  127116. "parameters": {
  127117. },
  127118. "attributes": {
  127119. "module_not_derived": "00000000000000000000000000000001",
  127120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127121. },
  127122. "port_directions": {
  127123. "C": "input",
  127124. "D": "input",
  127125. "Q": "output"
  127126. },
  127127. "connections": {
  127128. "C": [ 42 ],
  127129. "D": [ 4915 ],
  127130. "Q": [ 3367 ]
  127131. }
  127132. },
  127133. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_1": {
  127134. "hide_name": 0,
  127135. "type": "SB_DFF",
  127136. "parameters": {
  127137. },
  127138. "attributes": {
  127139. "module_not_derived": "00000000000000000000000000000001",
  127140. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127141. },
  127142. "port_directions": {
  127143. "C": "input",
  127144. "D": "input",
  127145. "Q": "output"
  127146. },
  127147. "connections": {
  127148. "C": [ 42 ],
  127149. "D": [ 4916 ],
  127150. "Q": [ 3358 ]
  127151. }
  127152. },
  127153. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_10": {
  127154. "hide_name": 0,
  127155. "type": "SB_DFF",
  127156. "parameters": {
  127157. },
  127158. "attributes": {
  127159. "module_not_derived": "00000000000000000000000000000001",
  127160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127161. },
  127162. "port_directions": {
  127163. "C": "input",
  127164. "D": "input",
  127165. "Q": "output"
  127166. },
  127167. "connections": {
  127168. "C": [ 42 ],
  127169. "D": [ 4917 ],
  127170. "Q": [ 3602 ]
  127171. }
  127172. },
  127173. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_11": {
  127174. "hide_name": 0,
  127175. "type": "SB_DFF",
  127176. "parameters": {
  127177. },
  127178. "attributes": {
  127179. "module_not_derived": "00000000000000000000000000000001",
  127180. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127181. },
  127182. "port_directions": {
  127183. "C": "input",
  127184. "D": "input",
  127185. "Q": "output"
  127186. },
  127187. "connections": {
  127188. "C": [ 42 ],
  127189. "D": [ 4918 ],
  127190. "Q": [ 3594 ]
  127191. }
  127192. },
  127193. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_12": {
  127194. "hide_name": 0,
  127195. "type": "SB_DFF",
  127196. "parameters": {
  127197. },
  127198. "attributes": {
  127199. "module_not_derived": "00000000000000000000000000000001",
  127200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127201. },
  127202. "port_directions": {
  127203. "C": "input",
  127204. "D": "input",
  127205. "Q": "output"
  127206. },
  127207. "connections": {
  127208. "C": [ 42 ],
  127209. "D": [ 4919 ],
  127210. "Q": [ 3586 ]
  127211. }
  127212. },
  127213. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_13": {
  127214. "hide_name": 0,
  127215. "type": "SB_DFF",
  127216. "parameters": {
  127217. },
  127218. "attributes": {
  127219. "module_not_derived": "00000000000000000000000000000001",
  127220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127221. },
  127222. "port_directions": {
  127223. "C": "input",
  127224. "D": "input",
  127225. "Q": "output"
  127226. },
  127227. "connections": {
  127228. "C": [ 42 ],
  127229. "D": [ 4920 ],
  127230. "Q": [ 3578 ]
  127231. }
  127232. },
  127233. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_14": {
  127234. "hide_name": 0,
  127235. "type": "SB_DFF",
  127236. "parameters": {
  127237. },
  127238. "attributes": {
  127239. "module_not_derived": "00000000000000000000000000000001",
  127240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127241. },
  127242. "port_directions": {
  127243. "C": "input",
  127244. "D": "input",
  127245. "Q": "output"
  127246. },
  127247. "connections": {
  127248. "C": [ 42 ],
  127249. "D": [ 4921 ],
  127250. "Q": [ 3553 ]
  127251. }
  127252. },
  127253. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_15": {
  127254. "hide_name": 0,
  127255. "type": "SB_DFF",
  127256. "parameters": {
  127257. },
  127258. "attributes": {
  127259. "module_not_derived": "00000000000000000000000000000001",
  127260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127261. },
  127262. "port_directions": {
  127263. "C": "input",
  127264. "D": "input",
  127265. "Q": "output"
  127266. },
  127267. "connections": {
  127268. "C": [ 42 ],
  127269. "D": [ 4922 ],
  127270. "Q": [ 3418 ]
  127271. }
  127272. },
  127273. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_16": {
  127274. "hide_name": 0,
  127275. "type": "SB_DFF",
  127276. "parameters": {
  127277. },
  127278. "attributes": {
  127279. "module_not_derived": "00000000000000000000000000000001",
  127280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127281. },
  127282. "port_directions": {
  127283. "C": "input",
  127284. "D": "input",
  127285. "Q": "output"
  127286. },
  127287. "connections": {
  127288. "C": [ 42 ],
  127289. "D": [ 4948 ],
  127290. "Q": [ 3422 ]
  127291. }
  127292. },
  127293. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_17": {
  127294. "hide_name": 0,
  127295. "type": "SB_DFF",
  127296. "parameters": {
  127297. },
  127298. "attributes": {
  127299. "module_not_derived": "00000000000000000000000000000001",
  127300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127301. },
  127302. "port_directions": {
  127303. "C": "input",
  127304. "D": "input",
  127305. "Q": "output"
  127306. },
  127307. "connections": {
  127308. "C": [ 42 ],
  127309. "D": [ 4947 ],
  127310. "Q": [ 3507 ]
  127311. }
  127312. },
  127313. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_18": {
  127314. "hide_name": 0,
  127315. "type": "SB_DFF",
  127316. "parameters": {
  127317. },
  127318. "attributes": {
  127319. "module_not_derived": "00000000000000000000000000000001",
  127320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127321. },
  127322. "port_directions": {
  127323. "C": "input",
  127324. "D": "input",
  127325. "Q": "output"
  127326. },
  127327. "connections": {
  127328. "C": [ 42 ],
  127329. "D": [ 4946 ],
  127330. "Q": [ 3516 ]
  127331. }
  127332. },
  127333. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_19": {
  127334. "hide_name": 0,
  127335. "type": "SB_DFF",
  127336. "parameters": {
  127337. },
  127338. "attributes": {
  127339. "module_not_derived": "00000000000000000000000000000001",
  127340. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127341. },
  127342. "port_directions": {
  127343. "C": "input",
  127344. "D": "input",
  127345. "Q": "output"
  127346. },
  127347. "connections": {
  127348. "C": [ 42 ],
  127349. "D": [ 4945 ],
  127350. "Q": [ 3527 ]
  127351. }
  127352. },
  127353. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_2": {
  127354. "hide_name": 0,
  127355. "type": "SB_DFF",
  127356. "parameters": {
  127357. },
  127358. "attributes": {
  127359. "module_not_derived": "00000000000000000000000000000001",
  127360. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127361. },
  127362. "port_directions": {
  127363. "C": "input",
  127364. "D": "input",
  127365. "Q": "output"
  127366. },
  127367. "connections": {
  127368. "C": [ 42 ],
  127369. "D": [ 4923 ],
  127370. "Q": [ 3349 ]
  127371. }
  127372. },
  127373. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_20": {
  127374. "hide_name": 0,
  127375. "type": "SB_DFF",
  127376. "parameters": {
  127377. },
  127378. "attributes": {
  127379. "module_not_derived": "00000000000000000000000000000001",
  127380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127381. },
  127382. "port_directions": {
  127383. "C": "input",
  127384. "D": "input",
  127385. "Q": "output"
  127386. },
  127387. "connections": {
  127388. "C": [ 42 ],
  127389. "D": [ 4944 ],
  127390. "Q": [ 3537 ]
  127391. }
  127392. },
  127393. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_21": {
  127394. "hide_name": 0,
  127395. "type": "SB_DFF",
  127396. "parameters": {
  127397. },
  127398. "attributes": {
  127399. "module_not_derived": "00000000000000000000000000000001",
  127400. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127401. },
  127402. "port_directions": {
  127403. "C": "input",
  127404. "D": "input",
  127405. "Q": "output"
  127406. },
  127407. "connections": {
  127408. "C": [ 42 ],
  127409. "D": [ 4943 ],
  127410. "Q": [ 3547 ]
  127411. }
  127412. },
  127413. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_22": {
  127414. "hide_name": 0,
  127415. "type": "SB_DFF",
  127416. "parameters": {
  127417. },
  127418. "attributes": {
  127419. "module_not_derived": "00000000000000000000000000000001",
  127420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127421. },
  127422. "port_directions": {
  127423. "C": "input",
  127424. "D": "input",
  127425. "Q": "output"
  127426. },
  127427. "connections": {
  127428. "C": [ 42 ],
  127429. "D": [ 4942 ],
  127430. "Q": [ 3377 ]
  127431. }
  127432. },
  127433. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_23": {
  127434. "hide_name": 0,
  127435. "type": "SB_DFF",
  127436. "parameters": {
  127437. },
  127438. "attributes": {
  127439. "module_not_derived": "00000000000000000000000000000001",
  127440. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127441. },
  127442. "port_directions": {
  127443. "C": "input",
  127444. "D": "input",
  127445. "Q": "output"
  127446. },
  127447. "connections": {
  127448. "C": [ 42 ],
  127449. "D": [ 4941 ],
  127450. "Q": [ 3381 ]
  127451. }
  127452. },
  127453. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_24": {
  127454. "hide_name": 0,
  127455. "type": "SB_DFF",
  127456. "parameters": {
  127457. },
  127458. "attributes": {
  127459. "module_not_derived": "00000000000000000000000000000001",
  127460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127461. },
  127462. "port_directions": {
  127463. "C": "input",
  127464. "D": "input",
  127465. "Q": "output"
  127466. },
  127467. "connections": {
  127468. "C": [ 42 ],
  127469. "D": [ 4940 ],
  127470. "Q": [ 3395 ]
  127471. }
  127472. },
  127473. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_25": {
  127474. "hide_name": 0,
  127475. "type": "SB_DFF",
  127476. "parameters": {
  127477. },
  127478. "attributes": {
  127479. "module_not_derived": "00000000000000000000000000000001",
  127480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127481. },
  127482. "port_directions": {
  127483. "C": "input",
  127484. "D": "input",
  127485. "Q": "output"
  127486. },
  127487. "connections": {
  127488. "C": [ 42 ],
  127489. "D": [ 4939 ],
  127490. "Q": [ 3412 ]
  127491. }
  127492. },
  127493. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_26": {
  127494. "hide_name": 0,
  127495. "type": "SB_DFF",
  127496. "parameters": {
  127497. },
  127498. "attributes": {
  127499. "module_not_derived": "00000000000000000000000000000001",
  127500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127501. },
  127502. "port_directions": {
  127503. "C": "input",
  127504. "D": "input",
  127505. "Q": "output"
  127506. },
  127507. "connections": {
  127508. "C": [ 42 ],
  127509. "D": [ 4938 ],
  127510. "Q": [ 3436 ]
  127511. }
  127512. },
  127513. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_27": {
  127514. "hide_name": 0,
  127515. "type": "SB_DFF",
  127516. "parameters": {
  127517. },
  127518. "attributes": {
  127519. "module_not_derived": "00000000000000000000000000000001",
  127520. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127521. },
  127522. "port_directions": {
  127523. "C": "input",
  127524. "D": "input",
  127525. "Q": "output"
  127526. },
  127527. "connections": {
  127528. "C": [ 42 ],
  127529. "D": [ 4937 ],
  127530. "Q": [ 3440 ]
  127531. }
  127532. },
  127533. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_28": {
  127534. "hide_name": 0,
  127535. "type": "SB_DFF",
  127536. "parameters": {
  127537. },
  127538. "attributes": {
  127539. "module_not_derived": "00000000000000000000000000000001",
  127540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127541. },
  127542. "port_directions": {
  127543. "C": "input",
  127544. "D": "input",
  127545. "Q": "output"
  127546. },
  127547. "connections": {
  127548. "C": [ 42 ],
  127549. "D": [ 4936 ],
  127550. "Q": [ 3456 ]
  127551. }
  127552. },
  127553. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_29": {
  127554. "hide_name": 0,
  127555. "type": "SB_DFF",
  127556. "parameters": {
  127557. },
  127558. "attributes": {
  127559. "module_not_derived": "00000000000000000000000000000001",
  127560. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127561. },
  127562. "port_directions": {
  127563. "C": "input",
  127564. "D": "input",
  127565. "Q": "output"
  127566. },
  127567. "connections": {
  127568. "C": [ 42 ],
  127569. "D": [ 4935 ],
  127570. "Q": [ 3469 ]
  127571. }
  127572. },
  127573. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_3": {
  127574. "hide_name": 0,
  127575. "type": "SB_DFF",
  127576. "parameters": {
  127577. },
  127578. "attributes": {
  127579. "module_not_derived": "00000000000000000000000000000001",
  127580. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127581. },
  127582. "port_directions": {
  127583. "C": "input",
  127584. "D": "input",
  127585. "Q": "output"
  127586. },
  127587. "connections": {
  127588. "C": [ 42 ],
  127589. "D": [ 4924 ],
  127590. "Q": [ 3340 ]
  127591. }
  127592. },
  127593. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_30": {
  127594. "hide_name": 0,
  127595. "type": "SB_DFF",
  127596. "parameters": {
  127597. },
  127598. "attributes": {
  127599. "module_not_derived": "00000000000000000000000000000001",
  127600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127601. },
  127602. "port_directions": {
  127603. "C": "input",
  127604. "D": "input",
  127605. "Q": "output"
  127606. },
  127607. "connections": {
  127608. "C": [ 42 ],
  127609. "D": [ 4934 ],
  127610. "Q": [ 3481 ]
  127611. }
  127612. },
  127613. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_31": {
  127614. "hide_name": 0,
  127615. "type": "SB_DFF",
  127616. "parameters": {
  127617. },
  127618. "attributes": {
  127619. "module_not_derived": "00000000000000000000000000000001",
  127620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127621. },
  127622. "port_directions": {
  127623. "C": "input",
  127624. "D": "input",
  127625. "Q": "output"
  127626. },
  127627. "connections": {
  127628. "C": [ 42 ],
  127629. "D": [ 4933 ],
  127630. "Q": [ 3494 ]
  127631. }
  127632. },
  127633. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_4": {
  127634. "hide_name": 0,
  127635. "type": "SB_DFF",
  127636. "parameters": {
  127637. },
  127638. "attributes": {
  127639. "module_not_derived": "00000000000000000000000000000001",
  127640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127641. },
  127642. "port_directions": {
  127643. "C": "input",
  127644. "D": "input",
  127645. "Q": "output"
  127646. },
  127647. "connections": {
  127648. "C": [ 42 ],
  127649. "D": [ 4925 ],
  127650. "Q": [ 3331 ]
  127651. }
  127652. },
  127653. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_5": {
  127654. "hide_name": 0,
  127655. "type": "SB_DFF",
  127656. "parameters": {
  127657. },
  127658. "attributes": {
  127659. "module_not_derived": "00000000000000000000000000000001",
  127660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127661. },
  127662. "port_directions": {
  127663. "C": "input",
  127664. "D": "input",
  127665. "Q": "output"
  127666. },
  127667. "connections": {
  127668. "C": [ 42 ],
  127669. "D": [ 4926 ],
  127670. "Q": [ 3323 ]
  127671. }
  127672. },
  127673. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_6": {
  127674. "hide_name": 0,
  127675. "type": "SB_DFF",
  127676. "parameters": {
  127677. },
  127678. "attributes": {
  127679. "module_not_derived": "00000000000000000000000000000001",
  127680. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127681. },
  127682. "port_directions": {
  127683. "C": "input",
  127684. "D": "input",
  127685. "Q": "output"
  127686. },
  127687. "connections": {
  127688. "C": [ 42 ],
  127689. "D": [ 4927 ],
  127690. "Q": [ 3311 ]
  127691. }
  127692. },
  127693. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_7": {
  127694. "hide_name": 0,
  127695. "type": "SB_DFF",
  127696. "parameters": {
  127697. },
  127698. "attributes": {
  127699. "module_not_derived": "00000000000000000000000000000001",
  127700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127701. },
  127702. "port_directions": {
  127703. "C": "input",
  127704. "D": "input",
  127705. "Q": "output"
  127706. },
  127707. "connections": {
  127708. "C": [ 42 ],
  127709. "D": [ 4928 ],
  127710. "Q": [ 3314 ]
  127711. }
  127712. },
  127713. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_8": {
  127714. "hide_name": 0,
  127715. "type": "SB_DFF",
  127716. "parameters": {
  127717. },
  127718. "attributes": {
  127719. "module_not_derived": "00000000000000000000000000000001",
  127720. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127721. },
  127722. "port_directions": {
  127723. "C": "input",
  127724. "D": "input",
  127725. "Q": "output"
  127726. },
  127727. "connections": {
  127728. "C": [ 42 ],
  127729. "D": [ 4929 ],
  127730. "Q": [ 3620 ]
  127731. }
  127732. },
  127733. "cpu_I.memory_to_writeBack_MUL_HH_SB_DFF_Q_9": {
  127734. "hide_name": 0,
  127735. "type": "SB_DFF",
  127736. "parameters": {
  127737. },
  127738. "attributes": {
  127739. "module_not_derived": "00000000000000000000000000000001",
  127740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127741. },
  127742. "port_directions": {
  127743. "C": "input",
  127744. "D": "input",
  127745. "Q": "output"
  127746. },
  127747. "connections": {
  127748. "C": [ 42 ],
  127749. "D": [ 4930 ],
  127750. "Q": [ 3611 ]
  127751. }
  127752. },
  127753. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q": {
  127754. "hide_name": 0,
  127755. "type": "SB_DFF",
  127756. "parameters": {
  127757. },
  127758. "attributes": {
  127759. "module_not_derived": "00000000000000000000000000000001",
  127760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127761. },
  127762. "port_directions": {
  127763. "C": "input",
  127764. "D": "input",
  127765. "Q": "output"
  127766. },
  127767. "connections": {
  127768. "C": [ 42 ],
  127769. "D": [ 5248 ],
  127770. "Q": [ 3310 ]
  127771. }
  127772. },
  127773. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_1": {
  127774. "hide_name": 0,
  127775. "type": "SB_DFF",
  127776. "parameters": {
  127777. },
  127778. "attributes": {
  127779. "module_not_derived": "00000000000000000000000000000001",
  127780. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127781. },
  127782. "port_directions": {
  127783. "C": "input",
  127784. "D": "input",
  127785. "Q": "output"
  127786. },
  127787. "connections": {
  127788. "C": [ 42 ],
  127789. "D": [ 5248 ],
  127790. "Q": [ 3577 ]
  127791. }
  127792. },
  127793. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_10": {
  127794. "hide_name": 0,
  127795. "type": "SB_DFF",
  127796. "parameters": {
  127797. },
  127798. "attributes": {
  127799. "module_not_derived": "00000000000000000000000000000001",
  127800. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127801. },
  127802. "port_directions": {
  127803. "C": "input",
  127804. "D": "input",
  127805. "Q": "output"
  127806. },
  127807. "connections": {
  127808. "C": [ 42 ],
  127809. "D": [ 5320 ],
  127810. "Q": [ 3376 ]
  127811. }
  127812. },
  127813. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_11": {
  127814. "hide_name": 0,
  127815. "type": "SB_DFF",
  127816. "parameters": {
  127817. },
  127818. "attributes": {
  127819. "module_not_derived": "00000000000000000000000000000001",
  127820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127821. },
  127822. "port_directions": {
  127823. "C": "input",
  127824. "D": "input",
  127825. "Q": "output"
  127826. },
  127827. "connections": {
  127828. "C": [ 42 ],
  127829. "D": [ 5316 ],
  127830. "Q": [ 3380 ]
  127831. }
  127832. },
  127833. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_12": {
  127834. "hide_name": 0,
  127835. "type": "SB_DFF",
  127836. "parameters": {
  127837. },
  127838. "attributes": {
  127839. "module_not_derived": "00000000000000000000000000000001",
  127840. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127841. },
  127842. "port_directions": {
  127843. "C": "input",
  127844. "D": "input",
  127845. "Q": "output"
  127846. },
  127847. "connections": {
  127848. "C": [ 42 ],
  127849. "D": [ 5312 ],
  127850. "Q": [ 3394 ]
  127851. }
  127852. },
  127853. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_13": {
  127854. "hide_name": 0,
  127855. "type": "SB_DFF",
  127856. "parameters": {
  127857. },
  127858. "attributes": {
  127859. "module_not_derived": "00000000000000000000000000000001",
  127860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127861. },
  127862. "port_directions": {
  127863. "C": "input",
  127864. "D": "input",
  127865. "Q": "output"
  127866. },
  127867. "connections": {
  127868. "C": [ 42 ],
  127869. "D": [ 5308 ],
  127870. "Q": [ 3411 ]
  127871. }
  127872. },
  127873. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_14": {
  127874. "hide_name": 0,
  127875. "type": "SB_DFF",
  127876. "parameters": {
  127877. },
  127878. "attributes": {
  127879. "module_not_derived": "00000000000000000000000000000001",
  127880. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127881. },
  127882. "port_directions": {
  127883. "C": "input",
  127884. "D": "input",
  127885. "Q": "output"
  127886. },
  127887. "connections": {
  127888. "C": [ 42 ],
  127889. "D": [ 5304 ],
  127890. "Q": [ 3435 ]
  127891. }
  127892. },
  127893. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_15": {
  127894. "hide_name": 0,
  127895. "type": "SB_DFF",
  127896. "parameters": {
  127897. },
  127898. "attributes": {
  127899. "module_not_derived": "00000000000000000000000000000001",
  127900. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127901. },
  127902. "port_directions": {
  127903. "C": "input",
  127904. "D": "input",
  127905. "Q": "output"
  127906. },
  127907. "connections": {
  127908. "C": [ 42 ],
  127909. "D": [ 5300 ],
  127910. "Q": [ 3439 ]
  127911. }
  127912. },
  127913. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_16": {
  127914. "hide_name": 0,
  127915. "type": "SB_DFF",
  127916. "parameters": {
  127917. },
  127918. "attributes": {
  127919. "module_not_derived": "00000000000000000000000000000001",
  127920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127921. },
  127922. "port_directions": {
  127923. "C": "input",
  127924. "D": "input",
  127925. "Q": "output"
  127926. },
  127927. "connections": {
  127928. "C": [ 42 ],
  127929. "D": [ 5291 ],
  127930. "Q": [ 3455 ]
  127931. }
  127932. },
  127933. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_17": {
  127934. "hide_name": 0,
  127935. "type": "SB_DFF",
  127936. "parameters": {
  127937. },
  127938. "attributes": {
  127939. "module_not_derived": "00000000000000000000000000000001",
  127940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127941. },
  127942. "port_directions": {
  127943. "C": "input",
  127944. "D": "input",
  127945. "Q": "output"
  127946. },
  127947. "connections": {
  127948. "C": [ 42 ],
  127949. "D": [ 5245 ],
  127950. "Q": [ 3468 ]
  127951. }
  127952. },
  127953. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_18": {
  127954. "hide_name": 0,
  127955. "type": "SB_DFF",
  127956. "parameters": {
  127957. },
  127958. "attributes": {
  127959. "module_not_derived": "00000000000000000000000000000001",
  127960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127961. },
  127962. "port_directions": {
  127963. "C": "input",
  127964. "D": "input",
  127965. "Q": "output"
  127966. },
  127967. "connections": {
  127968. "C": [ 42 ],
  127969. "D": [ 5287 ],
  127970. "Q": [ 3480 ]
  127971. }
  127972. },
  127973. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_19": {
  127974. "hide_name": 0,
  127975. "type": "SB_DFF",
  127976. "parameters": {
  127977. },
  127978. "attributes": {
  127979. "module_not_derived": "00000000000000000000000000000001",
  127980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  127981. },
  127982. "port_directions": {
  127983. "C": "input",
  127984. "D": "input",
  127985. "Q": "output"
  127986. },
  127987. "connections": {
  127988. "C": [ 42 ],
  127989. "D": [ 5283 ],
  127990. "Q": [ 3493 ]
  127991. }
  127992. },
  127993. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_2": {
  127994. "hide_name": 0,
  127995. "type": "SB_DFF",
  127996. "parameters": {
  127997. },
  127998. "attributes": {
  127999. "module_not_derived": "00000000000000000000000000000001",
  128000. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128001. },
  128002. "port_directions": {
  128003. "C": "input",
  128004. "D": "input",
  128005. "Q": "output"
  128006. },
  128007. "connections": {
  128008. "C": [ 42 ],
  128009. "D": [ 5353 ],
  128010. "Q": [ 3552 ]
  128011. }
  128012. },
  128013. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_20": {
  128014. "hide_name": 0,
  128015. "type": "SB_DFF",
  128016. "parameters": {
  128017. },
  128018. "attributes": {
  128019. "module_not_derived": "00000000000000000000000000000001",
  128020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128021. },
  128022. "port_directions": {
  128023. "C": "input",
  128024. "D": "input",
  128025. "Q": "output"
  128026. },
  128027. "connections": {
  128028. "C": [ 42 ],
  128029. "D": [ 5279 ],
  128030. "Q": [ 3365 ]
  128031. }
  128032. },
  128033. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_21": {
  128034. "hide_name": 0,
  128035. "type": "SB_DFF",
  128036. "parameters": {
  128037. },
  128038. "attributes": {
  128039. "module_not_derived": "00000000000000000000000000000001",
  128040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128041. },
  128042. "port_directions": {
  128043. "C": "input",
  128044. "D": "input",
  128045. "Q": "output"
  128046. },
  128047. "connections": {
  128048. "C": [ 42 ],
  128049. "D": [ 5275 ],
  128050. "Q": [ 3356 ]
  128051. }
  128052. },
  128053. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_22": {
  128054. "hide_name": 0,
  128055. "type": "SB_DFF",
  128056. "parameters": {
  128057. },
  128058. "attributes": {
  128059. "module_not_derived": "00000000000000000000000000000001",
  128060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128061. },
  128062. "port_directions": {
  128063. "C": "input",
  128064. "D": "input",
  128065. "Q": "output"
  128066. },
  128067. "connections": {
  128068. "C": [ 42 ],
  128069. "D": [ 5271 ],
  128070. "Q": [ 3347 ]
  128071. }
  128072. },
  128073. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_23": {
  128074. "hide_name": 0,
  128075. "type": "SB_DFF",
  128076. "parameters": {
  128077. },
  128078. "attributes": {
  128079. "module_not_derived": "00000000000000000000000000000001",
  128080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128081. },
  128082. "port_directions": {
  128083. "C": "input",
  128084. "D": "input",
  128085. "Q": "output"
  128086. },
  128087. "connections": {
  128088. "C": [ 42 ],
  128089. "D": [ 5267 ],
  128090. "Q": [ 3338 ]
  128091. }
  128092. },
  128093. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_24": {
  128094. "hide_name": 0,
  128095. "type": "SB_DFF",
  128096. "parameters": {
  128097. },
  128098. "attributes": {
  128099. "module_not_derived": "00000000000000000000000000000001",
  128100. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128101. },
  128102. "port_directions": {
  128103. "C": "input",
  128104. "D": "input",
  128105. "Q": "output"
  128106. },
  128107. "connections": {
  128108. "C": [ 42 ],
  128109. "D": [ 5263 ],
  128110. "Q": [ 3329 ]
  128111. }
  128112. },
  128113. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_25": {
  128114. "hide_name": 0,
  128115. "type": "SB_DFF",
  128116. "parameters": {
  128117. },
  128118. "attributes": {
  128119. "module_not_derived": "00000000000000000000000000000001",
  128120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128121. },
  128122. "port_directions": {
  128123. "C": "input",
  128124. "D": "input",
  128125. "Q": "output"
  128126. },
  128127. "connections": {
  128128. "C": [ 42 ],
  128129. "D": [ 5259 ],
  128130. "Q": [ 3321 ]
  128131. }
  128132. },
  128133. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_26": {
  128134. "hide_name": 0,
  128135. "type": "SB_DFF",
  128136. "parameters": {
  128137. },
  128138. "attributes": {
  128139. "module_not_derived": "00000000000000000000000000000001",
  128140. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128141. },
  128142. "port_directions": {
  128143. "C": "input",
  128144. "D": "input",
  128145. "Q": "output"
  128146. },
  128147. "connections": {
  128148. "C": [ 42 ],
  128149. "D": [ 5252 ],
  128150. "Q": [ 3307 ]
  128151. }
  128152. },
  128153. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_27": {
  128154. "hide_name": 0,
  128155. "type": "SB_DFF",
  128156. "parameters": {
  128157. },
  128158. "attributes": {
  128159. "module_not_derived": "00000000000000000000000000000001",
  128160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128161. },
  128162. "port_directions": {
  128163. "C": "input",
  128164. "D": "input",
  128165. "Q": "output"
  128166. },
  128167. "connections": {
  128168. "C": [ 42 ],
  128169. "D": [ 5375 ],
  128170. "Q": [ 3626 ]
  128171. }
  128172. },
  128173. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_28": {
  128174. "hide_name": 0,
  128175. "type": "SB_DFF",
  128176. "parameters": {
  128177. },
  128178. "attributes": {
  128179. "module_not_derived": "00000000000000000000000000000001",
  128180. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128181. },
  128182. "port_directions": {
  128183. "C": "input",
  128184. "D": "input",
  128185. "Q": "output"
  128186. },
  128187. "connections": {
  128188. "C": [ 42 ],
  128189. "D": [ 5374 ],
  128190. "Q": [ 3618 ]
  128191. }
  128192. },
  128193. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_29": {
  128194. "hide_name": 0,
  128195. "type": "SB_DFF",
  128196. "parameters": {
  128197. },
  128198. "attributes": {
  128199. "module_not_derived": "00000000000000000000000000000001",
  128200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128201. },
  128202. "port_directions": {
  128203. "C": "input",
  128204. "D": "input",
  128205. "Q": "output"
  128206. },
  128207. "connections": {
  128208. "C": [ 42 ],
  128209. "D": [ 5370 ],
  128210. "Q": [ 3609 ]
  128211. }
  128212. },
  128213. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_3": {
  128214. "hide_name": 0,
  128215. "type": "SB_DFF",
  128216. "parameters": {
  128217. },
  128218. "attributes": {
  128219. "module_not_derived": "00000000000000000000000000000001",
  128220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128221. },
  128222. "port_directions": {
  128223. "C": "input",
  128224. "D": "input",
  128225. "Q": "output"
  128226. },
  128227. "connections": {
  128228. "C": [ 42 ],
  128229. "D": [ 5352 ],
  128230. "Q": [ 3417 ]
  128231. }
  128232. },
  128233. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_30": {
  128234. "hide_name": 0,
  128235. "type": "SB_DFF",
  128236. "parameters": {
  128237. },
  128238. "attributes": {
  128239. "module_not_derived": "00000000000000000000000000000001",
  128240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128241. },
  128242. "port_directions": {
  128243. "C": "input",
  128244. "D": "input",
  128245. "Q": "output"
  128246. },
  128247. "connections": {
  128248. "C": [ 42 ],
  128249. "D": [ 5366 ],
  128250. "Q": [ 3600 ]
  128251. }
  128252. },
  128253. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_31": {
  128254. "hide_name": 0,
  128255. "type": "SB_DFF",
  128256. "parameters": {
  128257. },
  128258. "attributes": {
  128259. "module_not_derived": "00000000000000000000000000000001",
  128260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128261. },
  128262. "port_directions": {
  128263. "C": "input",
  128264. "D": "input",
  128265. "Q": "output"
  128266. },
  128267. "connections": {
  128268. "C": [ 42 ],
  128269. "D": [ 5362 ],
  128270. "Q": [ 3592 ]
  128271. }
  128272. },
  128273. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_32": {
  128274. "hide_name": 0,
  128275. "type": "SB_DFF",
  128276. "parameters": {
  128277. },
  128278. "attributes": {
  128279. "module_not_derived": "00000000000000000000000000000001",
  128280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128281. },
  128282. "port_directions": {
  128283. "C": "input",
  128284. "D": "input",
  128285. "Q": "output"
  128286. },
  128287. "connections": {
  128288. "C": [ 42 ],
  128289. "D": [ 5358 ],
  128290. "Q": [ 3584 ]
  128291. }
  128292. },
  128293. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_33": {
  128294. "hide_name": 0,
  128295. "type": "SB_DFF",
  128296. "parameters": {
  128297. },
  128298. "attributes": {
  128299. "module_not_derived": "00000000000000000000000000000001",
  128300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128301. },
  128302. "port_directions": {
  128303. "C": "input",
  128304. "D": "input",
  128305. "Q": "output"
  128306. },
  128307. "connections": {
  128308. "C": [ 42 ],
  128309. "D": [ 5340 ],
  128310. "Q": [ 3575 ]
  128311. }
  128312. },
  128313. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_34": {
  128314. "hide_name": 0,
  128315. "type": "SB_DFF",
  128316. "parameters": {
  128317. },
  128318. "attributes": {
  128319. "module_not_derived": "00000000000000000000000000000001",
  128320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128321. },
  128322. "port_directions": {
  128323. "C": "input",
  128324. "D": "input",
  128325. "Q": "output"
  128326. },
  128327. "connections": {
  128328. "C": [ 42 ],
  128329. "D": [ 5296 ],
  128330. "Q": [ 3550 ]
  128331. }
  128332. },
  128333. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_35": {
  128334. "hide_name": 0,
  128335. "type": "SB_DFF",
  128336. "parameters": {
  128337. },
  128338. "attributes": {
  128339. "module_not_derived": "00000000000000000000000000000001",
  128340. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128341. },
  128342. "port_directions": {
  128343. "C": "input",
  128344. "D": "input",
  128345. "Q": "output"
  128346. },
  128347. "connections": {
  128348. "C": [ 42 ],
  128349. "D": [ 5354 ],
  128350. "Q": [ 3415 ]
  128351. }
  128352. },
  128353. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_36": {
  128354. "hide_name": 0,
  128355. "type": "SB_DFF",
  128356. "parameters": {
  128357. },
  128358. "attributes": {
  128359. "module_not_derived": "00000000000000000000000000000001",
  128360. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128361. },
  128362. "port_directions": {
  128363. "C": "input",
  128364. "D": "input",
  128365. "Q": "output"
  128366. },
  128367. "connections": {
  128368. "C": [ 42 ],
  128369. "D": [ 5040 ],
  128370. "Q": [ 3503 ]
  128371. }
  128372. },
  128373. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_37": {
  128374. "hide_name": 0,
  128375. "type": "SB_DFF",
  128376. "parameters": {
  128377. },
  128378. "attributes": {
  128379. "module_not_derived": "00000000000000000000000000000001",
  128380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128381. },
  128382. "port_directions": {
  128383. "C": "input",
  128384. "D": "input",
  128385. "Q": "output"
  128386. },
  128387. "connections": {
  128388. "C": [ 42 ],
  128389. "D": [ 5039 ],
  128390. "Q": [ 3512 ]
  128391. }
  128392. },
  128393. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_38": {
  128394. "hide_name": 0,
  128395. "type": "SB_DFF",
  128396. "parameters": {
  128397. },
  128398. "attributes": {
  128399. "module_not_derived": "00000000000000000000000000000001",
  128400. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128401. },
  128402. "port_directions": {
  128403. "C": "input",
  128404. "D": "input",
  128405. "Q": "output"
  128406. },
  128407. "connections": {
  128408. "C": [ 42 ],
  128409. "D": [ 5038 ],
  128410. "Q": [ 3523 ]
  128411. }
  128412. },
  128413. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_39": {
  128414. "hide_name": 0,
  128415. "type": "SB_DFF",
  128416. "parameters": {
  128417. },
  128418. "attributes": {
  128419. "module_not_derived": "00000000000000000000000000000001",
  128420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128421. },
  128422. "port_directions": {
  128423. "C": "input",
  128424. "D": "input",
  128425. "Q": "output"
  128426. },
  128427. "connections": {
  128428. "C": [ 42 ],
  128429. "D": [ 5037 ],
  128430. "Q": [ 3533 ]
  128431. }
  128432. },
  128433. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_4": {
  128434. "hide_name": 0,
  128435. "type": "SB_DFF",
  128436. "parameters": {
  128437. },
  128438. "attributes": {
  128439. "module_not_derived": "00000000000000000000000000000001",
  128440. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128441. },
  128442. "port_directions": {
  128443. "C": "input",
  128444. "D": "input",
  128445. "Q": "output"
  128446. },
  128447. "connections": {
  128448. "C": [ 42 ],
  128449. "D": [ 5348 ],
  128450. "Q": [ 3421 ]
  128451. }
  128452. },
  128453. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_40": {
  128454. "hide_name": 0,
  128455. "type": "SB_DFF",
  128456. "parameters": {
  128457. },
  128458. "attributes": {
  128459. "module_not_derived": "00000000000000000000000000000001",
  128460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128461. },
  128462. "port_directions": {
  128463. "C": "input",
  128464. "D": "input",
  128465. "Q": "output"
  128466. },
  128467. "connections": {
  128468. "C": [ 42 ],
  128469. "D": [ 5036 ],
  128470. "Q": [ 3543 ]
  128471. }
  128472. },
  128473. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_41": {
  128474. "hide_name": 0,
  128475. "type": "SB_DFF",
  128476. "parameters": {
  128477. },
  128478. "attributes": {
  128479. "module_not_derived": "00000000000000000000000000000001",
  128480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128481. },
  128482. "port_directions": {
  128483. "C": "input",
  128484. "D": "input",
  128485. "Q": "output"
  128486. },
  128487. "connections": {
  128488. "C": [ 42 ],
  128489. "D": [ 5035 ],
  128490. "Q": [ 3562 ]
  128491. }
  128492. },
  128493. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_42": {
  128494. "hide_name": 0,
  128495. "type": "SB_DFF",
  128496. "parameters": {
  128497. },
  128498. "attributes": {
  128499. "module_not_derived": "00000000000000000000000000000001",
  128500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128501. },
  128502. "port_directions": {
  128503. "C": "input",
  128504. "D": "input",
  128505. "Q": "output"
  128506. },
  128507. "connections": {
  128508. "C": [ 42 ],
  128509. "D": [ 5034 ],
  128510. "Q": [ 3374 ]
  128511. }
  128512. },
  128513. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_43": {
  128514. "hide_name": 0,
  128515. "type": "SB_DFF",
  128516. "parameters": {
  128517. },
  128518. "attributes": {
  128519. "module_not_derived": "00000000000000000000000000000001",
  128520. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128521. },
  128522. "port_directions": {
  128523. "C": "input",
  128524. "D": "input",
  128525. "Q": "output"
  128526. },
  128527. "connections": {
  128528. "C": [ 42 ],
  128529. "D": [ 5033 ],
  128530. "Q": [ 3391 ]
  128531. }
  128532. },
  128533. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_44": {
  128534. "hide_name": 0,
  128535. "type": "SB_DFF",
  128536. "parameters": {
  128537. },
  128538. "attributes": {
  128539. "module_not_derived": "00000000000000000000000000000001",
  128540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128541. },
  128542. "port_directions": {
  128543. "C": "input",
  128544. "D": "input",
  128545. "Q": "output"
  128546. },
  128547. "connections": {
  128548. "C": [ 42 ],
  128549. "D": [ 5032 ],
  128550. "Q": [ 3408 ]
  128551. }
  128552. },
  128553. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_45": {
  128554. "hide_name": 0,
  128555. "type": "SB_DFF",
  128556. "parameters": {
  128557. },
  128558. "attributes": {
  128559. "module_not_derived": "00000000000000000000000000000001",
  128560. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128561. },
  128562. "port_directions": {
  128563. "C": "input",
  128564. "D": "input",
  128565. "Q": "output"
  128566. },
  128567. "connections": {
  128568. "C": [ 42 ],
  128569. "D": [ 5031 ],
  128570. "Q": [ 3631 ]
  128571. }
  128572. },
  128573. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_46": {
  128574. "hide_name": 0,
  128575. "type": "SB_DFF",
  128576. "parameters": {
  128577. },
  128578. "attributes": {
  128579. "module_not_derived": "00000000000000000000000000000001",
  128580. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128581. },
  128582. "port_directions": {
  128583. "C": "input",
  128584. "D": "input",
  128585. "Q": "output"
  128586. },
  128587. "connections": {
  128588. "C": [ 42 ],
  128589. "D": [ 5030 ],
  128590. "Q": [ 3433 ]
  128591. }
  128592. },
  128593. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_47": {
  128594. "hide_name": 0,
  128595. "type": "SB_DFF",
  128596. "parameters": {
  128597. },
  128598. "attributes": {
  128599. "module_not_derived": "00000000000000000000000000000001",
  128600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128601. },
  128602. "port_directions": {
  128603. "C": "input",
  128604. "D": "input",
  128605. "Q": "output"
  128606. },
  128607. "connections": {
  128608. "C": [ 42 ],
  128609. "D": [ 5029 ],
  128610. "Q": [ 3452 ]
  128611. }
  128612. },
  128613. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_48": {
  128614. "hide_name": 0,
  128615. "type": "SB_DFF",
  128616. "parameters": {
  128617. },
  128618. "attributes": {
  128619. "module_not_derived": "00000000000000000000000000000001",
  128620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128621. },
  128622. "port_directions": {
  128623. "C": "input",
  128624. "D": "input",
  128625. "Q": "output"
  128626. },
  128627. "connections": {
  128628. "C": [ 42 ],
  128629. "D": [ 5028 ],
  128630. "Q": [ 3465 ]
  128631. }
  128632. },
  128633. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_49": {
  128634. "hide_name": 0,
  128635. "type": "SB_DFF",
  128636. "parameters": {
  128637. },
  128638. "attributes": {
  128639. "module_not_derived": "00000000000000000000000000000001",
  128640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128641. },
  128642. "port_directions": {
  128643. "C": "input",
  128644. "D": "input",
  128645. "Q": "output"
  128646. },
  128647. "connections": {
  128648. "C": [ 42 ],
  128649. "D": [ 5027 ],
  128650. "Q": [ 3477 ]
  128651. }
  128652. },
  128653. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_5": {
  128654. "hide_name": 0,
  128655. "type": "SB_DFF",
  128656. "parameters": {
  128657. },
  128658. "attributes": {
  128659. "module_not_derived": "00000000000000000000000000000001",
  128660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128661. },
  128662. "port_directions": {
  128663. "C": "input",
  128664. "D": "input",
  128665. "Q": "output"
  128666. },
  128667. "connections": {
  128668. "C": [ 42 ],
  128669. "D": [ 5344 ],
  128670. "Q": [ 3506 ]
  128671. }
  128672. },
  128673. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_50": {
  128674. "hide_name": 0,
  128675. "type": "SB_DFF",
  128676. "parameters": {
  128677. },
  128678. "attributes": {
  128679. "module_not_derived": "00000000000000000000000000000001",
  128680. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128681. },
  128682. "port_directions": {
  128683. "C": "input",
  128684. "D": "input",
  128685. "Q": "output"
  128686. },
  128687. "connections": {
  128688. "C": [ 42 ],
  128689. "D": [ 5026 ],
  128690. "Q": [ 3491 ]
  128691. }
  128692. },
  128693. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_51": {
  128694. "hide_name": 0,
  128695. "type": "SB_DFF",
  128696. "parameters": {
  128697. },
  128698. "attributes": {
  128699. "module_not_derived": "00000000000000000000000000000001",
  128700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128701. },
  128702. "port_directions": {
  128703. "C": "input",
  128704. "D": "input",
  128705. "Q": "output"
  128706. },
  128707. "connections": {
  128708. "C": [ 42 ],
  128709. "D": [ 5025 ],
  128710. "Q": [ 3569 ]
  128711. }
  128712. },
  128713. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_6": {
  128714. "hide_name": 0,
  128715. "type": "SB_DFF",
  128716. "parameters": {
  128717. },
  128718. "attributes": {
  128719. "module_not_derived": "00000000000000000000000000000001",
  128720. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128721. },
  128722. "port_directions": {
  128723. "C": "input",
  128724. "D": "input",
  128725. "Q": "output"
  128726. },
  128727. "connections": {
  128728. "C": [ 42 ],
  128729. "D": [ 5336 ],
  128730. "Q": [ 3515 ]
  128731. }
  128732. },
  128733. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_7": {
  128734. "hide_name": 0,
  128735. "type": "SB_DFF",
  128736. "parameters": {
  128737. },
  128738. "attributes": {
  128739. "module_not_derived": "00000000000000000000000000000001",
  128740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128741. },
  128742. "port_directions": {
  128743. "C": "input",
  128744. "D": "input",
  128745. "Q": "output"
  128746. },
  128747. "connections": {
  128748. "C": [ 42 ],
  128749. "D": [ 5332 ],
  128750. "Q": [ 3526 ]
  128751. }
  128752. },
  128753. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_8": {
  128754. "hide_name": 0,
  128755. "type": "SB_DFF",
  128756. "parameters": {
  128757. },
  128758. "attributes": {
  128759. "module_not_derived": "00000000000000000000000000000001",
  128760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128761. },
  128762. "port_directions": {
  128763. "C": "input",
  128764. "D": "input",
  128765. "Q": "output"
  128766. },
  128767. "connections": {
  128768. "C": [ 42 ],
  128769. "D": [ 5328 ],
  128770. "Q": [ 3536 ]
  128771. }
  128772. },
  128773. "cpu_I.memory_to_writeBack_MUL_LOW_SB_DFF_Q_9": {
  128774. "hide_name": 0,
  128775. "type": "SB_DFF",
  128776. "parameters": {
  128777. },
  128778. "attributes": {
  128779. "module_not_derived": "00000000000000000000000000000001",
  128780. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  128781. },
  128782. "port_directions": {
  128783. "C": "input",
  128784. "D": "input",
  128785. "Q": "output"
  128786. },
  128787. "connections": {
  128788. "C": [ 42 ],
  128789. "D": [ 5324 ],
  128790. "Q": [ 3546 ]
  128791. }
  128792. },
  128793. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q": {
  128794. "hide_name": 0,
  128795. "type": "SB_DFFE",
  128796. "parameters": {
  128797. },
  128798. "attributes": {
  128799. "module_not_derived": "00000000000000000000000000000001",
  128800. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128801. },
  128802. "port_directions": {
  128803. "C": "input",
  128804. "D": "input",
  128805. "E": "input",
  128806. "Q": "output"
  128807. },
  128808. "connections": {
  128809. "C": [ 42 ],
  128810. "D": [ 5058 ],
  128811. "E": [ 1026 ],
  128812. "Q": [ 2826 ]
  128813. }
  128814. },
  128815. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_1": {
  128816. "hide_name": 0,
  128817. "type": "SB_DFFE",
  128818. "parameters": {
  128819. },
  128820. "attributes": {
  128821. "module_not_derived": "00000000000000000000000000000001",
  128822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128823. },
  128824. "port_directions": {
  128825. "C": "input",
  128826. "D": "input",
  128827. "E": "input",
  128828. "Q": "output"
  128829. },
  128830. "connections": {
  128831. "C": [ 42 ],
  128832. "D": [ 5059 ],
  128833. "E": [ 1026 ],
  128834. "Q": [ 2824 ]
  128835. }
  128836. },
  128837. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_10": {
  128838. "hide_name": 0,
  128839. "type": "SB_DFFE",
  128840. "parameters": {
  128841. },
  128842. "attributes": {
  128843. "module_not_derived": "00000000000000000000000000000001",
  128844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128845. },
  128846. "port_directions": {
  128847. "C": "input",
  128848. "D": "input",
  128849. "E": "input",
  128850. "Q": "output"
  128851. },
  128852. "connections": {
  128853. "C": [ 42 ],
  128854. "D": [ 5060 ],
  128855. "E": [ 1026 ],
  128856. "Q": [ 2804 ]
  128857. }
  128858. },
  128859. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_11": {
  128860. "hide_name": 0,
  128861. "type": "SB_DFFE",
  128862. "parameters": {
  128863. },
  128864. "attributes": {
  128865. "module_not_derived": "00000000000000000000000000000001",
  128866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128867. },
  128868. "port_directions": {
  128869. "C": "input",
  128870. "D": "input",
  128871. "E": "input",
  128872. "Q": "output"
  128873. },
  128874. "connections": {
  128875. "C": [ 42 ],
  128876. "D": [ 5061 ],
  128877. "E": [ 1026 ],
  128878. "Q": [ 2802 ]
  128879. }
  128880. },
  128881. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_12": {
  128882. "hide_name": 0,
  128883. "type": "SB_DFFE",
  128884. "parameters": {
  128885. },
  128886. "attributes": {
  128887. "module_not_derived": "00000000000000000000000000000001",
  128888. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128889. },
  128890. "port_directions": {
  128891. "C": "input",
  128892. "D": "input",
  128893. "E": "input",
  128894. "Q": "output"
  128895. },
  128896. "connections": {
  128897. "C": [ 42 ],
  128898. "D": [ 5062 ],
  128899. "E": [ 1026 ],
  128900. "Q": [ 2800 ]
  128901. }
  128902. },
  128903. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_13": {
  128904. "hide_name": 0,
  128905. "type": "SB_DFFE",
  128906. "parameters": {
  128907. },
  128908. "attributes": {
  128909. "module_not_derived": "00000000000000000000000000000001",
  128910. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128911. },
  128912. "port_directions": {
  128913. "C": "input",
  128914. "D": "input",
  128915. "E": "input",
  128916. "Q": "output"
  128917. },
  128918. "connections": {
  128919. "C": [ 42 ],
  128920. "D": [ 5063 ],
  128921. "E": [ 1026 ],
  128922. "Q": [ 2798 ]
  128923. }
  128924. },
  128925. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_14": {
  128926. "hide_name": 0,
  128927. "type": "SB_DFFE",
  128928. "parameters": {
  128929. },
  128930. "attributes": {
  128931. "module_not_derived": "00000000000000000000000000000001",
  128932. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128933. },
  128934. "port_directions": {
  128935. "C": "input",
  128936. "D": "input",
  128937. "E": "input",
  128938. "Q": "output"
  128939. },
  128940. "connections": {
  128941. "C": [ 42 ],
  128942. "D": [ 5064 ],
  128943. "E": [ 1026 ],
  128944. "Q": [ 2796 ]
  128945. }
  128946. },
  128947. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_15": {
  128948. "hide_name": 0,
  128949. "type": "SB_DFFE",
  128950. "parameters": {
  128951. },
  128952. "attributes": {
  128953. "module_not_derived": "00000000000000000000000000000001",
  128954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128955. },
  128956. "port_directions": {
  128957. "C": "input",
  128958. "D": "input",
  128959. "E": "input",
  128960. "Q": "output"
  128961. },
  128962. "connections": {
  128963. "C": [ 42 ],
  128964. "D": [ 5065 ],
  128965. "E": [ 1026 ],
  128966. "Q": [ 2794 ]
  128967. }
  128968. },
  128969. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_16": {
  128970. "hide_name": 0,
  128971. "type": "SB_DFFE",
  128972. "parameters": {
  128973. },
  128974. "attributes": {
  128975. "module_not_derived": "00000000000000000000000000000001",
  128976. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128977. },
  128978. "port_directions": {
  128979. "C": "input",
  128980. "D": "input",
  128981. "E": "input",
  128982. "Q": "output"
  128983. },
  128984. "connections": {
  128985. "C": [ 42 ],
  128986. "D": [ 5066 ],
  128987. "E": [ 1026 ],
  128988. "Q": [ 2792 ]
  128989. }
  128990. },
  128991. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_17": {
  128992. "hide_name": 0,
  128993. "type": "SB_DFFE",
  128994. "parameters": {
  128995. },
  128996. "attributes": {
  128997. "module_not_derived": "00000000000000000000000000000001",
  128998. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  128999. },
  129000. "port_directions": {
  129001. "C": "input",
  129002. "D": "input",
  129003. "E": "input",
  129004. "Q": "output"
  129005. },
  129006. "connections": {
  129007. "C": [ 42 ],
  129008. "D": [ 5067 ],
  129009. "E": [ 1026 ],
  129010. "Q": [ 2790 ]
  129011. }
  129012. },
  129013. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_18": {
  129014. "hide_name": 0,
  129015. "type": "SB_DFFE",
  129016. "parameters": {
  129017. },
  129018. "attributes": {
  129019. "module_not_derived": "00000000000000000000000000000001",
  129020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129021. },
  129022. "port_directions": {
  129023. "C": "input",
  129024. "D": "input",
  129025. "E": "input",
  129026. "Q": "output"
  129027. },
  129028. "connections": {
  129029. "C": [ 42 ],
  129030. "D": [ 5068 ],
  129031. "E": [ 1026 ],
  129032. "Q": [ 2788 ]
  129033. }
  129034. },
  129035. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_19": {
  129036. "hide_name": 0,
  129037. "type": "SB_DFFE",
  129038. "parameters": {
  129039. },
  129040. "attributes": {
  129041. "module_not_derived": "00000000000000000000000000000001",
  129042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129043. },
  129044. "port_directions": {
  129045. "C": "input",
  129046. "D": "input",
  129047. "E": "input",
  129048. "Q": "output"
  129049. },
  129050. "connections": {
  129051. "C": [ 42 ],
  129052. "D": [ 5069 ],
  129053. "E": [ 1026 ],
  129054. "Q": [ 2786 ]
  129055. }
  129056. },
  129057. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_2": {
  129058. "hide_name": 0,
  129059. "type": "SB_DFFE",
  129060. "parameters": {
  129061. },
  129062. "attributes": {
  129063. "module_not_derived": "00000000000000000000000000000001",
  129064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129065. },
  129066. "port_directions": {
  129067. "C": "input",
  129068. "D": "input",
  129069. "E": "input",
  129070. "Q": "output"
  129071. },
  129072. "connections": {
  129073. "C": [ 42 ],
  129074. "D": [ 5070 ],
  129075. "E": [ 1026 ],
  129076. "Q": [ 2822 ]
  129077. }
  129078. },
  129079. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_20": {
  129080. "hide_name": 0,
  129081. "type": "SB_DFFE",
  129082. "parameters": {
  129083. },
  129084. "attributes": {
  129085. "module_not_derived": "00000000000000000000000000000001",
  129086. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129087. },
  129088. "port_directions": {
  129089. "C": "input",
  129090. "D": "input",
  129091. "E": "input",
  129092. "Q": "output"
  129093. },
  129094. "connections": {
  129095. "C": [ 42 ],
  129096. "D": [ 5071 ],
  129097. "E": [ 1026 ],
  129098. "Q": [ 2840 ]
  129099. }
  129100. },
  129101. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_21": {
  129102. "hide_name": 0,
  129103. "type": "SB_DFFE",
  129104. "parameters": {
  129105. },
  129106. "attributes": {
  129107. "module_not_derived": "00000000000000000000000000000001",
  129108. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129109. },
  129110. "port_directions": {
  129111. "C": "input",
  129112. "D": "input",
  129113. "E": "input",
  129114. "Q": "output"
  129115. },
  129116. "connections": {
  129117. "C": [ 42 ],
  129118. "D": [ 5072 ],
  129119. "E": [ 1026 ],
  129120. "Q": [ 2838 ]
  129121. }
  129122. },
  129123. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_22": {
  129124. "hide_name": 0,
  129125. "type": "SB_DFFE",
  129126. "parameters": {
  129127. },
  129128. "attributes": {
  129129. "module_not_derived": "00000000000000000000000000000001",
  129130. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129131. },
  129132. "port_directions": {
  129133. "C": "input",
  129134. "D": "input",
  129135. "E": "input",
  129136. "Q": "output"
  129137. },
  129138. "connections": {
  129139. "C": [ 42 ],
  129140. "D": [ 5073 ],
  129141. "E": [ 1026 ],
  129142. "Q": [ 2836 ]
  129143. }
  129144. },
  129145. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_23": {
  129146. "hide_name": 0,
  129147. "type": "SB_DFFE",
  129148. "parameters": {
  129149. },
  129150. "attributes": {
  129151. "module_not_derived": "00000000000000000000000000000001",
  129152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129153. },
  129154. "port_directions": {
  129155. "C": "input",
  129156. "D": "input",
  129157. "E": "input",
  129158. "Q": "output"
  129159. },
  129160. "connections": {
  129161. "C": [ 42 ],
  129162. "D": [ 5074 ],
  129163. "E": [ 1026 ],
  129164. "Q": [ 3976 ]
  129165. }
  129166. },
  129167. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_24": {
  129168. "hide_name": 0,
  129169. "type": "SB_DFFE",
  129170. "parameters": {
  129171. },
  129172. "attributes": {
  129173. "module_not_derived": "00000000000000000000000000000001",
  129174. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129175. },
  129176. "port_directions": {
  129177. "C": "input",
  129178. "D": "input",
  129179. "E": "input",
  129180. "Q": "output"
  129181. },
  129182. "connections": {
  129183. "C": [ 42 ],
  129184. "D": [ 5075 ],
  129185. "E": [ 1026 ],
  129186. "Q": [ 2833 ]
  129187. }
  129188. },
  129189. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_25": {
  129190. "hide_name": 0,
  129191. "type": "SB_DFFE",
  129192. "parameters": {
  129193. },
  129194. "attributes": {
  129195. "module_not_derived": "00000000000000000000000000000001",
  129196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129197. },
  129198. "port_directions": {
  129199. "C": "input",
  129200. "D": "input",
  129201. "E": "input",
  129202. "Q": "output"
  129203. },
  129204. "connections": {
  129205. "C": [ 42 ],
  129206. "D": [ 5076 ],
  129207. "E": [ 1026 ],
  129208. "Q": [ 2831 ]
  129209. }
  129210. },
  129211. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_26": {
  129212. "hide_name": 0,
  129213. "type": "SB_DFFE",
  129214. "parameters": {
  129215. },
  129216. "attributes": {
  129217. "module_not_derived": "00000000000000000000000000000001",
  129218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129219. },
  129220. "port_directions": {
  129221. "C": "input",
  129222. "D": "input",
  129223. "E": "input",
  129224. "Q": "output"
  129225. },
  129226. "connections": {
  129227. "C": [ 42 ],
  129228. "D": [ 5077 ],
  129229. "E": [ 1026 ],
  129230. "Q": [ 2829 ]
  129231. }
  129232. },
  129233. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_27": {
  129234. "hide_name": 0,
  129235. "type": "SB_DFFE",
  129236. "parameters": {
  129237. },
  129238. "attributes": {
  129239. "module_not_derived": "00000000000000000000000000000001",
  129240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129241. },
  129242. "port_directions": {
  129243. "C": "input",
  129244. "D": "input",
  129245. "E": "input",
  129246. "Q": "output"
  129247. },
  129248. "connections": {
  129249. "C": [ 42 ],
  129250. "D": [ 5078 ],
  129251. "E": [ 1026 ],
  129252. "Q": [ 2827 ]
  129253. }
  129254. },
  129255. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_28": {
  129256. "hide_name": 0,
  129257. "type": "SB_DFFE",
  129258. "parameters": {
  129259. },
  129260. "attributes": {
  129261. "module_not_derived": "00000000000000000000000000000001",
  129262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129263. },
  129264. "port_directions": {
  129265. "C": "input",
  129266. "D": "input",
  129267. "E": "input",
  129268. "Q": "output"
  129269. },
  129270. "connections": {
  129271. "C": [ 42 ],
  129272. "D": [ 5079 ],
  129273. "E": [ 1026 ],
  129274. "Q": [ 2805 ]
  129275. }
  129276. },
  129277. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_29": {
  129278. "hide_name": 0,
  129279. "type": "SB_DFFE",
  129280. "parameters": {
  129281. },
  129282. "attributes": {
  129283. "module_not_derived": "00000000000000000000000000000001",
  129284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129285. },
  129286. "port_directions": {
  129287. "C": "input",
  129288. "D": "input",
  129289. "E": "input",
  129290. "Q": "output"
  129291. },
  129292. "connections": {
  129293. "C": [ 42 ],
  129294. "D": [ 5080 ],
  129295. "E": [ 1026 ],
  129296. "Q": [ 2841 ]
  129297. }
  129298. },
  129299. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_3": {
  129300. "hide_name": 0,
  129301. "type": "SB_DFFE",
  129302. "parameters": {
  129303. },
  129304. "attributes": {
  129305. "module_not_derived": "00000000000000000000000000000001",
  129306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129307. },
  129308. "port_directions": {
  129309. "C": "input",
  129310. "D": "input",
  129311. "E": "input",
  129312. "Q": "output"
  129313. },
  129314. "connections": {
  129315. "C": [ 42 ],
  129316. "D": [ 5081 ],
  129317. "E": [ 1026 ],
  129318. "Q": [ 2820 ]
  129319. }
  129320. },
  129321. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_4": {
  129322. "hide_name": 0,
  129323. "type": "SB_DFFE",
  129324. "parameters": {
  129325. },
  129326. "attributes": {
  129327. "module_not_derived": "00000000000000000000000000000001",
  129328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129329. },
  129330. "port_directions": {
  129331. "C": "input",
  129332. "D": "input",
  129333. "E": "input",
  129334. "Q": "output"
  129335. },
  129336. "connections": {
  129337. "C": [ 42 ],
  129338. "D": [ 5082 ],
  129339. "E": [ 1026 ],
  129340. "Q": [ 2818 ]
  129341. }
  129342. },
  129343. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_5": {
  129344. "hide_name": 0,
  129345. "type": "SB_DFFE",
  129346. "parameters": {
  129347. },
  129348. "attributes": {
  129349. "module_not_derived": "00000000000000000000000000000001",
  129350. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129351. },
  129352. "port_directions": {
  129353. "C": "input",
  129354. "D": "input",
  129355. "E": "input",
  129356. "Q": "output"
  129357. },
  129358. "connections": {
  129359. "C": [ 42 ],
  129360. "D": [ 5083 ],
  129361. "E": [ 1026 ],
  129362. "Q": [ 2816 ]
  129363. }
  129364. },
  129365. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_6": {
  129366. "hide_name": 0,
  129367. "type": "SB_DFFE",
  129368. "parameters": {
  129369. },
  129370. "attributes": {
  129371. "module_not_derived": "00000000000000000000000000000001",
  129372. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129373. },
  129374. "port_directions": {
  129375. "C": "input",
  129376. "D": "input",
  129377. "E": "input",
  129378. "Q": "output"
  129379. },
  129380. "connections": {
  129381. "C": [ 42 ],
  129382. "D": [ 5084 ],
  129383. "E": [ 1026 ],
  129384. "Q": [ 2814 ]
  129385. }
  129386. },
  129387. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_7": {
  129388. "hide_name": 0,
  129389. "type": "SB_DFFE",
  129390. "parameters": {
  129391. },
  129392. "attributes": {
  129393. "module_not_derived": "00000000000000000000000000000001",
  129394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129395. },
  129396. "port_directions": {
  129397. "C": "input",
  129398. "D": "input",
  129399. "E": "input",
  129400. "Q": "output"
  129401. },
  129402. "connections": {
  129403. "C": [ 42 ],
  129404. "D": [ 5085 ],
  129405. "E": [ 1026 ],
  129406. "Q": [ 2812 ]
  129407. }
  129408. },
  129409. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_8": {
  129410. "hide_name": 0,
  129411. "type": "SB_DFFE",
  129412. "parameters": {
  129413. },
  129414. "attributes": {
  129415. "module_not_derived": "00000000000000000000000000000001",
  129416. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129417. },
  129418. "port_directions": {
  129419. "C": "input",
  129420. "D": "input",
  129421. "E": "input",
  129422. "Q": "output"
  129423. },
  129424. "connections": {
  129425. "C": [ 42 ],
  129426. "D": [ 5086 ],
  129427. "E": [ 1026 ],
  129428. "Q": [ 2810 ]
  129429. }
  129430. },
  129431. "cpu_I.memory_to_writeBack_PC_SB_DFFE_Q_9": {
  129432. "hide_name": 0,
  129433. "type": "SB_DFFE",
  129434. "parameters": {
  129435. },
  129436. "attributes": {
  129437. "module_not_derived": "00000000000000000000000000000001",
  129438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  129439. },
  129440. "port_directions": {
  129441. "C": "input",
  129442. "D": "input",
  129443. "E": "input",
  129444. "Q": "output"
  129445. },
  129446. "connections": {
  129447. "C": [ 42 ],
  129448. "D": [ 5087 ],
  129449. "E": [ 1026 ],
  129450. "Q": [ 2808 ]
  129451. }
  129452. },
  129453. "cpu_I.memory_to_writeBack_REGFILE_WRITE_VALID_SB_DFF_Q": {
  129454. "hide_name": 0,
  129455. "type": "SB_DFF",
  129456. "parameters": {
  129457. },
  129458. "attributes": {
  129459. "module_not_derived": "00000000000000000000000000000001",
  129460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4563.3-4901.6|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129461. },
  129462. "port_directions": {
  129463. "C": "input",
  129464. "D": "input",
  129465. "Q": "output"
  129466. },
  129467. "connections": {
  129468. "C": [ 42 ],
  129469. "D": [ 4895 ],
  129470. "Q": [ 2325 ]
  129471. }
  129472. },
  129473. "memctrl_I.cf_wren_SB_DFF_Q": {
  129474. "hide_name": 0,
  129475. "type": "SB_DFF",
  129476. "parameters": {
  129477. },
  129478. "attributes": {
  129479. "module_not_derived": "00000000000000000000000000000001",
  129480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:359.2-360.63|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129481. },
  129482. "port_directions": {
  129483. "C": "input",
  129484. "D": "input",
  129485. "Q": "output"
  129486. },
  129487. "connections": {
  129488. "C": [ 42 ],
  129489. "D": [ 5384 ],
  129490. "Q": [ 5385 ]
  129491. }
  129492. },
  129493. "memctrl_I.cf_wren_SB_DFF_Q_D_SB_LUT4_O": {
  129494. "hide_name": 0,
  129495. "type": "SB_LUT4",
  129496. "parameters": {
  129497. "LUT_INIT": "0000000000110000"
  129498. },
  129499. "attributes": {
  129500. "module_not_derived": "00000000000000000000000000000001",
  129501. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  129502. },
  129503. "port_directions": {
  129504. "I0": "input",
  129505. "I1": "input",
  129506. "I2": "input",
  129507. "I3": "input",
  129508. "O": "output"
  129509. },
  129510. "connections": {
  129511. "I0": [ "0" ],
  129512. "I1": [ 5386 ],
  129513. "I2": [ 5387 ],
  129514. "I3": [ 5388 ],
  129515. "O": [ 5384 ]
  129516. }
  129517. },
  129518. "memctrl_I.cf_wren_SB_LUT4_I1": {
  129519. "hide_name": 0,
  129520. "type": "SB_LUT4",
  129521. "parameters": {
  129522. "LUT_INIT": "1101111111111111"
  129523. },
  129524. "attributes": {
  129525. "module_not_derived": "00000000000000000000000000000001",
  129526. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  129527. },
  129528. "port_directions": {
  129529. "I0": "input",
  129530. "I1": "input",
  129531. "I2": "input",
  129532. "I3": "input",
  129533. "O": "output"
  129534. },
  129535. "connections": {
  129536. "I0": [ 5389 ],
  129537. "I1": [ 5385 ],
  129538. "I2": [ 5386 ],
  129539. "I3": [ 5390 ],
  129540. "O": [ 5391 ]
  129541. }
  129542. },
  129543. "memctrl_I.cf_wren_SB_LUT4_I1_O_SB_DFFER_D": {
  129544. "hide_name": 0,
  129545. "type": "SB_DFFER",
  129546. "parameters": {
  129547. },
  129548. "attributes": {
  129549. "module_not_derived": "00000000000000000000000000000001",
  129550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:64.4-68.60|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  129551. },
  129552. "port_directions": {
  129553. "C": "input",
  129554. "D": "input",
  129555. "E": "input",
  129556. "Q": "output",
  129557. "R": "input"
  129558. },
  129559. "connections": {
  129560. "C": [ 42 ],
  129561. "D": [ 5391 ],
  129562. "E": [ 5392 ],
  129563. "Q": [ 5386 ],
  129564. "R": [ 127 ]
  129565. }
  129566. },
  129567. "memctrl_I.cf_wren_SB_LUT4_I1_O_SB_DFFER_D_Q_SB_LUT4_O": {
  129568. "hide_name": 0,
  129569. "type": "SB_LUT4",
  129570. "parameters": {
  129571. "LUT_INIT": "0000000000000011"
  129572. },
  129573. "attributes": {
  129574. "module_not_derived": "00000000000000000000000000000001",
  129575. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  129576. },
  129577. "port_directions": {
  129578. "I0": "input",
  129579. "I1": "input",
  129580. "I2": "input",
  129581. "I3": "input",
  129582. "O": "output"
  129583. },
  129584. "connections": {
  129585. "I0": [ "0" ],
  129586. "I1": [ 5393 ],
  129587. "I2": [ 5394 ],
  129588. "I3": [ 5395 ],
  129589. "O": [ 5396 ]
  129590. }
  129591. },
  129592. "memctrl_I.dly_si_dst.dl[0]_SB_DFF_Q": {
  129593. "hide_name": 0,
  129594. "type": "SB_DFF",
  129595. "parameters": {
  129596. },
  129597. "attributes": {
  129598. "module_not_derived": "00000000000000000000000000000001",
  129599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:58.2-59.14|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129600. },
  129601. "port_directions": {
  129602. "C": "input",
  129603. "D": "input",
  129604. "Q": "output"
  129605. },
  129606. "connections": {
  129607. "C": [ 42 ],
  129608. "D": [ 5397 ],
  129609. "Q": [ 5398 ]
  129610. }
  129611. },
  129612. "memctrl_I.dly_si_dst.dl[0]_SB_DFF_Q_1": {
  129613. "hide_name": 0,
  129614. "type": "SB_DFF",
  129615. "parameters": {
  129616. },
  129617. "attributes": {
  129618. "module_not_derived": "00000000000000000000000000000001",
  129619. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:58.2-59.14|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129620. },
  129621. "port_directions": {
  129622. "C": "input",
  129623. "D": "input",
  129624. "Q": "output"
  129625. },
  129626. "connections": {
  129627. "C": [ 42 ],
  129628. "D": [ 5399 ],
  129629. "Q": [ 5400 ]
  129630. }
  129631. },
  129632. "memctrl_I.dly_si_dst.dl[1]_SB_DFF_Q": {
  129633. "hide_name": 0,
  129634. "type": "SB_DFF",
  129635. "parameters": {
  129636. },
  129637. "attributes": {
  129638. "module_not_derived": "00000000000000000000000000000001",
  129639. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:63.4-64.22|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129640. },
  129641. "port_directions": {
  129642. "C": "input",
  129643. "D": "input",
  129644. "Q": "output"
  129645. },
  129646. "connections": {
  129647. "C": [ 42 ],
  129648. "D": [ 5398 ],
  129649. "Q": [ 5401 ]
  129650. }
  129651. },
  129652. "memctrl_I.dly_si_dst.dl[1]_SB_DFF_Q_1": {
  129653. "hide_name": 0,
  129654. "type": "SB_DFF",
  129655. "parameters": {
  129656. },
  129657. "attributes": {
  129658. "module_not_derived": "00000000000000000000000000000001",
  129659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:63.4-64.22|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129660. },
  129661. "port_directions": {
  129662. "C": "input",
  129663. "D": "input",
  129664. "Q": "output"
  129665. },
  129666. "connections": {
  129667. "C": [ 42 ],
  129668. "D": [ 5400 ],
  129669. "Q": [ 5402 ]
  129670. }
  129671. },
  129672. "memctrl_I.dly_si_dst.dl[2]_SB_DFF_Q": {
  129673. "hide_name": 0,
  129674. "type": "SB_DFF",
  129675. "parameters": {
  129676. },
  129677. "attributes": {
  129678. "module_not_derived": "00000000000000000000000000000001",
  129679. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:63.4-64.22|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129680. },
  129681. "port_directions": {
  129682. "C": "input",
  129683. "D": "input",
  129684. "Q": "output"
  129685. },
  129686. "connections": {
  129687. "C": [ 42 ],
  129688. "D": [ 5401 ],
  129689. "Q": [ 646 ]
  129690. }
  129691. },
  129692. "memctrl_I.dly_si_dst.dl[2]_SB_DFF_Q_1": {
  129693. "hide_name": 0,
  129694. "type": "SB_DFF",
  129695. "parameters": {
  129696. },
  129697. "attributes": {
  129698. "module_not_derived": "00000000000000000000000000000001",
  129699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:63.4-64.22|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129700. },
  129701. "port_directions": {
  129702. "C": "input",
  129703. "D": "input",
  129704. "Q": "output"
  129705. },
  129706. "connections": {
  129707. "C": [ 42 ],
  129708. "D": [ 5402 ],
  129709. "Q": [ 640 ]
  129710. }
  129711. },
  129712. "memctrl_I.dly_si_mode.d_SB_DFFESS_Q": {
  129713. "hide_name": 0,
  129714. "type": "SB_DFFESS",
  129715. "parameters": {
  129716. },
  129717. "attributes": {
  129718. "module_not_derived": "00000000000000000000000000000001",
  129719. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:684.2-688.6|/usr/bin/../share/yosys/ice40/ff_map.v:25.66-25.119"
  129720. },
  129721. "port_directions": {
  129722. "C": "input",
  129723. "D": "input",
  129724. "E": "input",
  129725. "Q": "output",
  129726. "S": "input"
  129727. },
  129728. "connections": {
  129729. "C": [ 42 ],
  129730. "D": [ 5403 ],
  129731. "E": [ 5390 ],
  129732. "Q": [ 5404 ],
  129733. "S": [ 5405 ]
  129734. }
  129735. },
  129736. "memctrl_I.dly_si_mode.dl_SB_DFF_Q": {
  129737. "hide_name": 0,
  129738. "type": "SB_DFF",
  129739. "parameters": {
  129740. },
  129741. "attributes": {
  129742. "module_not_derived": "00000000000000000000000000000001",
  129743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129744. },
  129745. "port_directions": {
  129746. "C": "input",
  129747. "D": "input",
  129748. "Q": "output"
  129749. },
  129750. "connections": {
  129751. "C": [ 42 ],
  129752. "D": [ 5406 ],
  129753. "Q": [ 5407 ]
  129754. }
  129755. },
  129756. "memctrl_I.dly_si_mode.dl_SB_DFF_Q_1": {
  129757. "hide_name": 0,
  129758. "type": "SB_DFF",
  129759. "parameters": {
  129760. },
  129761. "attributes": {
  129762. "module_not_derived": "00000000000000000000000000000001",
  129763. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129764. },
  129765. "port_directions": {
  129766. "C": "input",
  129767. "D": "input",
  129768. "Q": "output"
  129769. },
  129770. "connections": {
  129771. "C": [ 42 ],
  129772. "D": [ 5408 ],
  129773. "Q": [ 5406 ]
  129774. }
  129775. },
  129776. "memctrl_I.dly_si_mode.dl_SB_DFF_Q_2": {
  129777. "hide_name": 0,
  129778. "type": "SB_DFF",
  129779. "parameters": {
  129780. },
  129781. "attributes": {
  129782. "module_not_derived": "00000000000000000000000000000001",
  129783. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129784. },
  129785. "port_directions": {
  129786. "C": "input",
  129787. "D": "input",
  129788. "Q": "output"
  129789. },
  129790. "connections": {
  129791. "C": [ 42 ],
  129792. "D": [ 5404 ],
  129793. "Q": [ 5408 ]
  129794. }
  129795. },
  129796. "memctrl_I.dly_si_mode.q_SB_DFF_Q": {
  129797. "hide_name": 0,
  129798. "type": "SB_DFF",
  129799. "parameters": {
  129800. },
  129801. "attributes": {
  129802. "module_not_derived": "00000000000000000000000000000001",
  129803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129804. },
  129805. "port_directions": {
  129806. "C": "input",
  129807. "D": "input",
  129808. "Q": "output"
  129809. },
  129810. "connections": {
  129811. "C": [ 42 ],
  129812. "D": [ 5407 ],
  129813. "Q": [ 5409 ]
  129814. }
  129815. },
  129816. "memctrl_I.ectl_cs_SB_DFF_Q": {
  129817. "hide_name": 0,
  129818. "type": "SB_DFF",
  129819. "parameters": {
  129820. },
  129821. "attributes": {
  129822. "module_not_derived": "00000000000000000000000000000001",
  129823. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:337.2-339.29|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129824. },
  129825. "port_directions": {
  129826. "C": "input",
  129827. "D": "input",
  129828. "Q": "output"
  129829. },
  129830. "connections": {
  129831. "C": [ 42 ],
  129832. "D": [ 5410 ],
  129833. "Q": [ 5411 ]
  129834. }
  129835. },
  129836. "memctrl_I.ectl_cs_SB_DFF_Q_1": {
  129837. "hide_name": 0,
  129838. "type": "SB_DFF",
  129839. "parameters": {
  129840. },
  129841. "attributes": {
  129842. "module_not_derived": "00000000000000000000000000000001",
  129843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:337.2-339.29|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129844. },
  129845. "port_directions": {
  129846. "C": "input",
  129847. "D": "input",
  129848. "Q": "output"
  129849. },
  129850. "connections": {
  129851. "C": [ 42 ],
  129852. "D": [ 5412 ],
  129853. "Q": [ 5413 ]
  129854. }
  129855. },
  129856. "memctrl_I.ectl_cs_SB_DFF_Q_1_D_SB_LUT4_O": {
  129857. "hide_name": 0,
  129858. "type": "SB_LUT4",
  129859. "parameters": {
  129860. "LUT_INIT": "1111000011001100"
  129861. },
  129862. "attributes": {
  129863. "module_not_derived": "00000000000000000000000000000001",
  129864. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  129865. },
  129866. "port_directions": {
  129867. "I0": "input",
  129868. "I1": "input",
  129869. "I2": "input",
  129870. "I3": "input",
  129871. "O": "output"
  129872. },
  129873. "connections": {
  129874. "I0": [ "0" ],
  129875. "I1": [ 5413 ],
  129876. "I2": [ 62 ],
  129877. "I3": [ 5414 ],
  129878. "O": [ 5412 ]
  129879. }
  129880. },
  129881. "memctrl_I.ectl_cs_SB_DFF_Q_D_SB_LUT4_O": {
  129882. "hide_name": 0,
  129883. "type": "SB_LUT4",
  129884. "parameters": {
  129885. "LUT_INIT": "1100110011110000"
  129886. },
  129887. "attributes": {
  129888. "module_not_derived": "00000000000000000000000000000001",
  129889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  129890. },
  129891. "port_directions": {
  129892. "I0": "input",
  129893. "I1": "input",
  129894. "I2": "input",
  129895. "I3": "input",
  129896. "O": "output"
  129897. },
  129898. "connections": {
  129899. "I0": [ "0" ],
  129900. "I1": [ 70 ],
  129901. "I2": [ 5411 ],
  129902. "I3": [ 5414 ],
  129903. "O": [ 5410 ]
  129904. }
  129905. },
  129906. "memctrl_I.ectl_cs_SB_DFF_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  129907. "hide_name": 0,
  129908. "type": "SB_LUT4",
  129909. "parameters": {
  129910. "LUT_INIT": "0011000000000000"
  129911. },
  129912. "attributes": {
  129913. "module_not_derived": "00000000000000000000000000000001",
  129914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  129915. },
  129916. "port_directions": {
  129917. "I0": "input",
  129918. "I1": "input",
  129919. "I2": "input",
  129920. "I3": "input",
  129921. "O": "output"
  129922. },
  129923. "connections": {
  129924. "I0": [ "0" ],
  129925. "I1": [ 697 ],
  129926. "I2": [ 469 ],
  129927. "I3": [ 5415 ],
  129928. "O": [ 5414 ]
  129929. }
  129930. },
  129931. "memctrl_I.ectl_grant_SB_DFF_Q": {
  129932. "hide_name": 0,
  129933. "type": "SB_DFF",
  129934. "parameters": {
  129935. },
  129936. "attributes": {
  129937. "module_not_derived": "00000000000000000000000000000001",
  129938. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  129939. },
  129940. "port_directions": {
  129941. "C": "input",
  129942. "D": "input",
  129943. "Q": "output"
  129944. },
  129945. "connections": {
  129946. "C": [ 42 ],
  129947. "D": [ 5416 ],
  129948. "Q": [ 5389 ]
  129949. }
  129950. },
  129951. "memctrl_I.ectl_grant_SB_LUT4_I0": {
  129952. "hide_name": 0,
  129953. "type": "SB_LUT4",
  129954. "parameters": {
  129955. "LUT_INIT": "0111000000000000"
  129956. },
  129957. "attributes": {
  129958. "module_not_derived": "00000000000000000000000000000001",
  129959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  129960. },
  129961. "port_directions": {
  129962. "I0": "input",
  129963. "I1": "input",
  129964. "I2": "input",
  129965. "I3": "input",
  129966. "O": "output"
  129967. },
  129968. "connections": {
  129969. "I0": [ 5389 ],
  129970. "I1": [ 5386 ],
  129971. "I2": [ 5390 ],
  129972. "I3": [ 5396 ],
  129973. "O": [ 5417 ]
  129974. }
  129975. },
  129976. "memctrl_I.ectl_grant_SB_LUT4_I1": {
  129977. "hide_name": 0,
  129978. "type": "SB_LUT4",
  129979. "parameters": {
  129980. "LUT_INIT": "0000110000000000"
  129981. },
  129982. "attributes": {
  129983. "module_not_derived": "00000000000000000000000000000001",
  129984. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  129985. },
  129986. "port_directions": {
  129987. "I0": "input",
  129988. "I1": "input",
  129989. "I2": "input",
  129990. "I3": "input",
  129991. "O": "output"
  129992. },
  129993. "connections": {
  129994. "I0": [ "0" ],
  129995. "I1": [ 5389 ],
  129996. "I2": [ 5394 ],
  129997. "I3": [ 5390 ],
  129998. "O": [ 5418 ]
  129999. }
  130000. },
  130001. "memctrl_I.ectl_grant_SB_LUT4_I1_1": {
  130002. "hide_name": 0,
  130003. "type": "SB_LUT4",
  130004. "parameters": {
  130005. "LUT_INIT": "0000001100000000"
  130006. },
  130007. "attributes": {
  130008. "module_not_derived": "00000000000000000000000000000001",
  130009. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  130010. },
  130011. "port_directions": {
  130012. "I0": "input",
  130013. "I1": "input",
  130014. "I2": "input",
  130015. "I3": "input",
  130016. "O": "output"
  130017. },
  130018. "connections": {
  130019. "I0": [ "0" ],
  130020. "I1": [ 5389 ],
  130021. "I2": [ 5394 ],
  130022. "I3": [ 5390 ],
  130023. "O": [ 5419 ]
  130024. }
  130025. },
  130026. "memctrl_I.ectl_grant_SB_LUT4_I1_1_O_SB_DFFER_Q": {
  130027. "hide_name": 0,
  130028. "type": "SB_DFFER",
  130029. "parameters": {
  130030. },
  130031. "attributes": {
  130032. "module_not_derived": "00000000000000000000000000000001",
  130033. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130034. },
  130035. "port_directions": {
  130036. "C": "input",
  130037. "D": "input",
  130038. "E": "input",
  130039. "Q": "output",
  130040. "R": "input"
  130041. },
  130042. "connections": {
  130043. "C": [ 42 ],
  130044. "D": [ 61 ],
  130045. "E": [ 5392 ],
  130046. "Q": [ 5420 ],
  130047. "R": [ 127 ]
  130048. }
  130049. },
  130050. "memctrl_I.ectl_grant_SB_LUT4_I1_O_SB_DFFER_Q": {
  130051. "hide_name": 0,
  130052. "type": "SB_DFFER",
  130053. "parameters": {
  130054. },
  130055. "attributes": {
  130056. "module_not_derived": "00000000000000000000000000000001",
  130057. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130058. },
  130059. "port_directions": {
  130060. "C": "input",
  130061. "D": "input",
  130062. "E": "input",
  130063. "Q": "output",
  130064. "R": "input"
  130065. },
  130066. "connections": {
  130067. "C": [ 42 ],
  130068. "D": [ 68 ],
  130069. "E": [ 5392 ],
  130070. "Q": [ 5421 ],
  130071. "R": [ 127 ]
  130072. }
  130073. },
  130074. "memctrl_I.ectl_grant_SB_LUT4_I1_O_SB_LUT4_O": {
  130075. "hide_name": 0,
  130076. "type": "SB_LUT4",
  130077. "parameters": {
  130078. "LUT_INIT": "1111000000000000"
  130079. },
  130080. "attributes": {
  130081. "module_not_derived": "00000000000000000000000000000001",
  130082. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  130083. },
  130084. "port_directions": {
  130085. "I0": "input",
  130086. "I1": "input",
  130087. "I2": "input",
  130088. "I3": "input",
  130089. "O": "output"
  130090. },
  130091. "connections": {
  130092. "I0": [ "0" ],
  130093. "I1": [ "0" ],
  130094. "I2": [ 5394 ],
  130095. "I3": [ 5390 ],
  130096. "O": [ 122 ]
  130097. }
  130098. },
  130099. "memctrl_I.ectl_req_SB_DFFSR_Q": {
  130100. "hide_name": 0,
  130101. "type": "SB_DFFSR",
  130102. "parameters": {
  130103. },
  130104. "attributes": {
  130105. "module_not_derived": "00000000000000000000000000000001",
  130106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:331.2-335.56|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  130107. },
  130108. "port_directions": {
  130109. "C": "input",
  130110. "D": "input",
  130111. "Q": "output",
  130112. "R": "input"
  130113. },
  130114. "connections": {
  130115. "C": [ 42 ],
  130116. "D": [ 5422 ],
  130117. "Q": [ 5423 ],
  130118. "R": [ 127 ]
  130119. }
  130120. },
  130121. "memctrl_I.ectl_req_SB_DFFSR_Q_D_SB_LUT4_O": {
  130122. "hide_name": 0,
  130123. "type": "SB_LUT4",
  130124. "parameters": {
  130125. "LUT_INIT": "1111010011001100"
  130126. },
  130127. "attributes": {
  130128. "module_not_derived": "00000000000000000000000000000001",
  130129. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  130130. },
  130131. "port_directions": {
  130132. "I0": "input",
  130133. "I1": "input",
  130134. "I2": "input",
  130135. "I3": "input",
  130136. "O": "output"
  130137. },
  130138. "connections": {
  130139. "I0": [ 64 ],
  130140. "I1": [ 5423 ],
  130141. "I2": [ 68 ],
  130142. "I3": [ 5414 ],
  130143. "O": [ 5422 ]
  130144. }
  130145. },
  130146. "memctrl_I.genblk1.cmd_fifo_I.ce_SB_LUT4_O": {
  130147. "hide_name": 0,
  130148. "type": "SB_LUT4",
  130149. "parameters": {
  130150. "LUT_INIT": "0000110010101100"
  130151. },
  130152. "attributes": {
  130153. "module_not_derived": "00000000000000000000000000000001",
  130154. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  130155. },
  130156. "port_directions": {
  130157. "I0": "input",
  130158. "I1": "input",
  130159. "I2": "input",
  130160. "I3": "input",
  130161. "O": "output"
  130162. },
  130163. "connections": {
  130164. "I0": [ 5389 ],
  130165. "I1": [ 5385 ],
  130166. "I2": [ 5386 ],
  130167. "I3": [ 5424 ],
  130168. "O": [ 5392 ]
  130169. }
  130170. },
  130171. "memctrl_I.genblk1.cmd_fifo_I.ce_SB_LUT4_O_I3_SB_LUT4_O": {
  130172. "hide_name": 0,
  130173. "type": "SB_LUT4",
  130174. "parameters": {
  130175. "LUT_INIT": "0000000011000000"
  130176. },
  130177. "attributes": {
  130178. "module_not_derived": "00000000000000000000000000000001",
  130179. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  130180. },
  130181. "port_directions": {
  130182. "I0": "input",
  130183. "I1": "input",
  130184. "I2": "input",
  130185. "I3": "input",
  130186. "O": "output"
  130187. },
  130188. "connections": {
  130189. "I0": [ "0" ],
  130190. "I1": [ 133 ],
  130191. "I2": [ 123 ],
  130192. "I3": [ 124 ],
  130193. "O": [ 463 ]
  130194. }
  130195. },
  130196. "memctrl_I.genblk1.rsp_fifo_I.ce_SB_LUT4_O": {
  130197. "hide_name": 0,
  130198. "type": "SB_LUT4",
  130199. "parameters": {
  130200. "LUT_INIT": "1111111100110000"
  130201. },
  130202. "attributes": {
  130203. "module_not_derived": "00000000000000000000000000000001",
  130204. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  130205. },
  130206. "port_directions": {
  130207. "I0": "input",
  130208. "I1": "input",
  130209. "I2": "input",
  130210. "I3": "input",
  130211. "O": "output"
  130212. },
  130213. "connections": {
  130214. "I0": [ "0" ],
  130215. "I1": [ 645 ],
  130216. "I2": [ 642 ],
  130217. "I3": [ 5425 ],
  130218. "O": [ 644 ]
  130219. }
  130220. },
  130221. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q": {
  130222. "hide_name": 0,
  130223. "type": "SB_DFFER",
  130224. "parameters": {
  130225. },
  130226. "attributes": {
  130227. "module_not_derived": "00000000000000000000000000000001",
  130228. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130229. },
  130230. "port_directions": {
  130231. "C": "input",
  130232. "D": "input",
  130233. "E": "input",
  130234. "Q": "output",
  130235. "R": "input"
  130236. },
  130237. "connections": {
  130238. "C": [ 42 ],
  130239. "D": [ 267 ],
  130240. "E": [ 644 ],
  130241. "Q": [ 5426 ],
  130242. "R": [ 127 ]
  130243. }
  130244. },
  130245. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_1": {
  130246. "hide_name": 0,
  130247. "type": "SB_DFFER",
  130248. "parameters": {
  130249. },
  130250. "attributes": {
  130251. "module_not_derived": "00000000000000000000000000000001",
  130252. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130253. },
  130254. "port_directions": {
  130255. "C": "input",
  130256. "D": "input",
  130257. "E": "input",
  130258. "Q": "output",
  130259. "R": "input"
  130260. },
  130261. "connections": {
  130262. "C": [ 42 ],
  130263. "D": [ 268 ],
  130264. "E": [ 644 ],
  130265. "Q": [ 5427 ],
  130266. "R": [ 127 ]
  130267. }
  130268. },
  130269. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_10": {
  130270. "hide_name": 0,
  130271. "type": "SB_DFFER",
  130272. "parameters": {
  130273. },
  130274. "attributes": {
  130275. "module_not_derived": "00000000000000000000000000000001",
  130276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130277. },
  130278. "port_directions": {
  130279. "C": "input",
  130280. "D": "input",
  130281. "E": "input",
  130282. "Q": "output",
  130283. "R": "input"
  130284. },
  130285. "connections": {
  130286. "C": [ 42 ],
  130287. "D": [ 265 ],
  130288. "E": [ 644 ],
  130289. "Q": [ 5428 ],
  130290. "R": [ 127 ]
  130291. }
  130292. },
  130293. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_11": {
  130294. "hide_name": 0,
  130295. "type": "SB_DFFER",
  130296. "parameters": {
  130297. },
  130298. "attributes": {
  130299. "module_not_derived": "00000000000000000000000000000001",
  130300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130301. },
  130302. "port_directions": {
  130303. "C": "input",
  130304. "D": "input",
  130305. "E": "input",
  130306. "Q": "output",
  130307. "R": "input"
  130308. },
  130309. "connections": {
  130310. "C": [ 42 ],
  130311. "D": [ 266 ],
  130312. "E": [ 644 ],
  130313. "Q": [ 5429 ],
  130314. "R": [ 127 ]
  130315. }
  130316. },
  130317. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_12": {
  130318. "hide_name": 0,
  130319. "type": "SB_DFFER",
  130320. "parameters": {
  130321. },
  130322. "attributes": {
  130323. "module_not_derived": "00000000000000000000000000000001",
  130324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130325. },
  130326. "port_directions": {
  130327. "C": "input",
  130328. "D": "input",
  130329. "E": "input",
  130330. "Q": "output",
  130331. "R": "input"
  130332. },
  130333. "connections": {
  130334. "C": [ 42 ],
  130335. "D": [ 223 ],
  130336. "E": [ 644 ],
  130337. "Q": [ 5430 ],
  130338. "R": [ 127 ]
  130339. }
  130340. },
  130341. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_13": {
  130342. "hide_name": 0,
  130343. "type": "SB_DFFER",
  130344. "parameters": {
  130345. },
  130346. "attributes": {
  130347. "module_not_derived": "00000000000000000000000000000001",
  130348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130349. },
  130350. "port_directions": {
  130351. "C": "input",
  130352. "D": "input",
  130353. "E": "input",
  130354. "Q": "output",
  130355. "R": "input"
  130356. },
  130357. "connections": {
  130358. "C": [ 42 ],
  130359. "D": [ 224 ],
  130360. "E": [ 644 ],
  130361. "Q": [ 5431 ],
  130362. "R": [ 127 ]
  130363. }
  130364. },
  130365. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_14": {
  130366. "hide_name": 0,
  130367. "type": "SB_DFFER",
  130368. "parameters": {
  130369. },
  130370. "attributes": {
  130371. "module_not_derived": "00000000000000000000000000000001",
  130372. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130373. },
  130374. "port_directions": {
  130375. "C": "input",
  130376. "D": "input",
  130377. "E": "input",
  130378. "Q": "output",
  130379. "R": "input"
  130380. },
  130381. "connections": {
  130382. "C": [ 42 ],
  130383. "D": [ 210 ],
  130384. "E": [ 644 ],
  130385. "Q": [ 5432 ],
  130386. "R": [ 127 ]
  130387. }
  130388. },
  130389. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_15": {
  130390. "hide_name": 0,
  130391. "type": "SB_DFFER",
  130392. "parameters": {
  130393. },
  130394. "attributes": {
  130395. "module_not_derived": "00000000000000000000000000000001",
  130396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130397. },
  130398. "port_directions": {
  130399. "C": "input",
  130400. "D": "input",
  130401. "E": "input",
  130402. "Q": "output",
  130403. "R": "input"
  130404. },
  130405. "connections": {
  130406. "C": [ 42 ],
  130407. "D": [ 211 ],
  130408. "E": [ 644 ],
  130409. "Q": [ 5433 ],
  130410. "R": [ 127 ]
  130411. }
  130412. },
  130413. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_16": {
  130414. "hide_name": 0,
  130415. "type": "SB_DFFER",
  130416. "parameters": {
  130417. },
  130418. "attributes": {
  130419. "module_not_derived": "00000000000000000000000000000001",
  130420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130421. },
  130422. "port_directions": {
  130423. "C": "input",
  130424. "D": "input",
  130425. "E": "input",
  130426. "Q": "output",
  130427. "R": "input"
  130428. },
  130429. "connections": {
  130430. "C": [ 42 ],
  130431. "D": [ 277 ],
  130432. "E": [ 644 ],
  130433. "Q": [ 5434 ],
  130434. "R": [ 127 ]
  130435. }
  130436. },
  130437. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_17": {
  130438. "hide_name": 0,
  130439. "type": "SB_DFFER",
  130440. "parameters": {
  130441. },
  130442. "attributes": {
  130443. "module_not_derived": "00000000000000000000000000000001",
  130444. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130445. },
  130446. "port_directions": {
  130447. "C": "input",
  130448. "D": "input",
  130449. "E": "input",
  130450. "Q": "output",
  130451. "R": "input"
  130452. },
  130453. "connections": {
  130454. "C": [ 42 ],
  130455. "D": [ 221 ],
  130456. "E": [ 644 ],
  130457. "Q": [ 5435 ],
  130458. "R": [ 127 ]
  130459. }
  130460. },
  130461. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_18": {
  130462. "hide_name": 0,
  130463. "type": "SB_DFFER",
  130464. "parameters": {
  130465. },
  130466. "attributes": {
  130467. "module_not_derived": "00000000000000000000000000000001",
  130468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130469. },
  130470. "port_directions": {
  130471. "C": "input",
  130472. "D": "input",
  130473. "E": "input",
  130474. "Q": "output",
  130475. "R": "input"
  130476. },
  130477. "connections": {
  130478. "C": [ 42 ],
  130479. "D": [ 222 ],
  130480. "E": [ 644 ],
  130481. "Q": [ 5436 ],
  130482. "R": [ 127 ]
  130483. }
  130484. },
  130485. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_19": {
  130486. "hide_name": 0,
  130487. "type": "SB_DFFER",
  130488. "parameters": {
  130489. },
  130490. "attributes": {
  130491. "module_not_derived": "00000000000000000000000000000001",
  130492. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130493. },
  130494. "port_directions": {
  130495. "C": "input",
  130496. "D": "input",
  130497. "E": "input",
  130498. "Q": "output",
  130499. "R": "input"
  130500. },
  130501. "connections": {
  130502. "C": [ 42 ],
  130503. "D": [ 280 ],
  130504. "E": [ 644 ],
  130505. "Q": [ 5437 ],
  130506. "R": [ 127 ]
  130507. }
  130508. },
  130509. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_2": {
  130510. "hide_name": 0,
  130511. "type": "SB_DFFER",
  130512. "parameters": {
  130513. },
  130514. "attributes": {
  130515. "module_not_derived": "00000000000000000000000000000001",
  130516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130517. },
  130518. "port_directions": {
  130519. "C": "input",
  130520. "D": "input",
  130521. "E": "input",
  130522. "Q": "output",
  130523. "R": "input"
  130524. },
  130525. "connections": {
  130526. "C": [ 42 ],
  130527. "D": [ 269 ],
  130528. "E": [ 644 ],
  130529. "Q": [ 5438 ],
  130530. "R": [ 127 ]
  130531. }
  130532. },
  130533. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_20": {
  130534. "hide_name": 0,
  130535. "type": "SB_DFFER",
  130536. "parameters": {
  130537. },
  130538. "attributes": {
  130539. "module_not_derived": "00000000000000000000000000000001",
  130540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130541. },
  130542. "port_directions": {
  130543. "C": "input",
  130544. "D": "input",
  130545. "E": "input",
  130546. "Q": "output",
  130547. "R": "input"
  130548. },
  130549. "connections": {
  130550. "C": [ 42 ],
  130551. "D": [ 271 ],
  130552. "E": [ 644 ],
  130553. "Q": [ 5439 ],
  130554. "R": [ 127 ]
  130555. }
  130556. },
  130557. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_21": {
  130558. "hide_name": 0,
  130559. "type": "SB_DFFER",
  130560. "parameters": {
  130561. },
  130562. "attributes": {
  130563. "module_not_derived": "00000000000000000000000000000001",
  130564. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130565. },
  130566. "port_directions": {
  130567. "C": "input",
  130568. "D": "input",
  130569. "E": "input",
  130570. "Q": "output",
  130571. "R": "input"
  130572. },
  130573. "connections": {
  130574. "C": [ 42 ],
  130575. "D": [ 225 ],
  130576. "E": [ 644 ],
  130577. "Q": [ 5440 ],
  130578. "R": [ 127 ]
  130579. }
  130580. },
  130581. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_3": {
  130582. "hide_name": 0,
  130583. "type": "SB_DFFER",
  130584. "parameters": {
  130585. },
  130586. "attributes": {
  130587. "module_not_derived": "00000000000000000000000000000001",
  130588. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130589. },
  130590. "port_directions": {
  130591. "C": "input",
  130592. "D": "input",
  130593. "E": "input",
  130594. "Q": "output",
  130595. "R": "input"
  130596. },
  130597. "connections": {
  130598. "C": [ 42 ],
  130599. "D": [ 270 ],
  130600. "E": [ 644 ],
  130601. "Q": [ 5441 ],
  130602. "R": [ 127 ]
  130603. }
  130604. },
  130605. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_4": {
  130606. "hide_name": 0,
  130607. "type": "SB_DFFER",
  130608. "parameters": {
  130609. },
  130610. "attributes": {
  130611. "module_not_derived": "00000000000000000000000000000001",
  130612. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130613. },
  130614. "port_directions": {
  130615. "C": "input",
  130616. "D": "input",
  130617. "E": "input",
  130618. "Q": "output",
  130619. "R": "input"
  130620. },
  130621. "connections": {
  130622. "C": [ 42 ],
  130623. "D": [ 212 ],
  130624. "E": [ 644 ],
  130625. "Q": [ 5442 ],
  130626. "R": [ 127 ]
  130627. }
  130628. },
  130629. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_5": {
  130630. "hide_name": 0,
  130631. "type": "SB_DFFER",
  130632. "parameters": {
  130633. },
  130634. "attributes": {
  130635. "module_not_derived": "00000000000000000000000000000001",
  130636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130637. },
  130638. "port_directions": {
  130639. "C": "input",
  130640. "D": "input",
  130641. "E": "input",
  130642. "Q": "output",
  130643. "R": "input"
  130644. },
  130645. "connections": {
  130646. "C": [ 42 ],
  130647. "D": [ 213 ],
  130648. "E": [ 644 ],
  130649. "Q": [ 5443 ],
  130650. "R": [ 127 ]
  130651. }
  130652. },
  130653. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_6": {
  130654. "hide_name": 0,
  130655. "type": "SB_DFFER",
  130656. "parameters": {
  130657. },
  130658. "attributes": {
  130659. "module_not_derived": "00000000000000000000000000000001",
  130660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130661. },
  130662. "port_directions": {
  130663. "C": "input",
  130664. "D": "input",
  130665. "E": "input",
  130666. "Q": "output",
  130667. "R": "input"
  130668. },
  130669. "connections": {
  130670. "C": [ 42 ],
  130671. "D": [ 214 ],
  130672. "E": [ 644 ],
  130673. "Q": [ 5444 ],
  130674. "R": [ 127 ]
  130675. }
  130676. },
  130677. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_7": {
  130678. "hide_name": 0,
  130679. "type": "SB_DFFER",
  130680. "parameters": {
  130681. },
  130682. "attributes": {
  130683. "module_not_derived": "00000000000000000000000000000001",
  130684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130685. },
  130686. "port_directions": {
  130687. "C": "input",
  130688. "D": "input",
  130689. "E": "input",
  130690. "Q": "output",
  130691. "R": "input"
  130692. },
  130693. "connections": {
  130694. "C": [ 42 ],
  130695. "D": [ 215 ],
  130696. "E": [ 644 ],
  130697. "Q": [ 5445 ],
  130698. "R": [ 127 ]
  130699. }
  130700. },
  130701. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_8": {
  130702. "hide_name": 0,
  130703. "type": "SB_DFFER",
  130704. "parameters": {
  130705. },
  130706. "attributes": {
  130707. "module_not_derived": "00000000000000000000000000000001",
  130708. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130709. },
  130710. "port_directions": {
  130711. "C": "input",
  130712. "D": "input",
  130713. "E": "input",
  130714. "Q": "output",
  130715. "R": "input"
  130716. },
  130717. "connections": {
  130718. "C": [ 42 ],
  130719. "D": [ 278 ],
  130720. "E": [ 644 ],
  130721. "Q": [ 5446 ],
  130722. "R": [ 127 ]
  130723. }
  130724. },
  130725. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data_SB_DFFER_Q_9": {
  130726. "hide_name": 0,
  130727. "type": "SB_DFFER",
  130728. "parameters": {
  130729. },
  130730. "attributes": {
  130731. "module_not_derived": "00000000000000000000000000000001",
  130732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  130733. },
  130734. "port_directions": {
  130735. "C": "input",
  130736. "D": "input",
  130737. "E": "input",
  130738. "Q": "output",
  130739. "R": "input"
  130740. },
  130741. "connections": {
  130742. "C": [ 42 ],
  130743. "D": [ 279 ],
  130744. "E": [ 644 ],
  130745. "Q": [ 5447 ],
  130746. "R": [ 127 ]
  130747. }
  130748. },
  130749. "memctrl_I.pause_cnt_SB_DFFSR_Q": {
  130750. "hide_name": 0,
  130751. "type": "SB_DFFSR",
  130752. "parameters": {
  130753. },
  130754. "attributes": {
  130755. "module_not_derived": "00000000000000000000000000000001",
  130756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:515.2-519.31|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  130757. },
  130758. "port_directions": {
  130759. "C": "input",
  130760. "D": "input",
  130761. "Q": "output",
  130762. "R": "input"
  130763. },
  130764. "connections": {
  130765. "C": [ 42 ],
  130766. "D": [ 5448 ],
  130767. "Q": [ 5449 ],
  130768. "R": [ 5450 ]
  130769. }
  130770. },
  130771. "memctrl_I.pause_cnt_SB_DFFSR_Q_R_SB_LUT4_O": {
  130772. "hide_name": 0,
  130773. "type": "SB_LUT4",
  130774. "parameters": {
  130775. "LUT_INIT": "0000000011111111"
  130776. },
  130777. "attributes": {
  130778. "module_not_derived": "00000000000000000000000000000001",
  130779. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  130780. },
  130781. "port_directions": {
  130782. "I0": "input",
  130783. "I1": "input",
  130784. "I2": "input",
  130785. "I3": "input",
  130786. "O": "output"
  130787. },
  130788. "connections": {
  130789. "I0": [ "0" ],
  130790. "I1": [ "0" ],
  130791. "I2": [ "0" ],
  130792. "I3": [ 5451 ],
  130793. "O": [ 5450 ]
  130794. }
  130795. },
  130796. "memctrl_I.pause_cnt_SB_DFFSS_Q": {
  130797. "hide_name": 0,
  130798. "type": "SB_DFFSS",
  130799. "parameters": {
  130800. },
  130801. "attributes": {
  130802. "module_not_derived": "00000000000000000000000000000001",
  130803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:515.2-519.31|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  130804. },
  130805. "port_directions": {
  130806. "C": "input",
  130807. "D": "input",
  130808. "Q": "output",
  130809. "S": "input"
  130810. },
  130811. "connections": {
  130812. "C": [ 42 ],
  130813. "D": [ 5452 ],
  130814. "Q": [ 5453 ],
  130815. "S": [ 5450 ]
  130816. }
  130817. },
  130818. "memctrl_I.pause_cnt_SB_DFFSS_Q_1": {
  130819. "hide_name": 0,
  130820. "type": "SB_DFFSS",
  130821. "parameters": {
  130822. },
  130823. "attributes": {
  130824. "module_not_derived": "00000000000000000000000000000001",
  130825. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:515.2-519.31|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  130826. },
  130827. "port_directions": {
  130828. "C": "input",
  130829. "D": "input",
  130830. "Q": "output",
  130831. "S": "input"
  130832. },
  130833. "connections": {
  130834. "C": [ 42 ],
  130835. "D": [ 5454 ],
  130836. "Q": [ 5455 ],
  130837. "S": [ 5450 ]
  130838. }
  130839. },
  130840. "memctrl_I.pause_last_SB_DFFSR_Q": {
  130841. "hide_name": 0,
  130842. "type": "SB_DFFSR",
  130843. "parameters": {
  130844. },
  130845. "attributes": {
  130846. "module_not_derived": "00000000000000000000000000000001",
  130847. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:515.2-519.31|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  130848. },
  130849. "port_directions": {
  130850. "C": "input",
  130851. "D": "input",
  130852. "Q": "output",
  130853. "R": "input"
  130854. },
  130855. "connections": {
  130856. "C": [ 42 ],
  130857. "D": [ 5456 ],
  130858. "Q": [ 5457 ],
  130859. "R": [ 5450 ]
  130860. }
  130861. },
  130862. "memctrl_I.pause_last_SB_LUT4_I1": {
  130863. "hide_name": 0,
  130864. "type": "SB_LUT4",
  130865. "parameters": {
  130866. "LUT_INIT": "0110100110010110"
  130867. },
  130868. "attributes": {
  130869. "module_not_derived": "00000000000000000000000000000001",
  130870. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  130871. },
  130872. "port_directions": {
  130873. "I0": "input",
  130874. "I1": "input",
  130875. "I2": "input",
  130876. "I3": "input",
  130877. "O": "output"
  130878. },
  130879. "connections": {
  130880. "I0": [ "0" ],
  130881. "I1": [ 5457 ],
  130882. "I2": [ "1" ],
  130883. "I3": [ 5458 ],
  130884. "O": [ 5456 ]
  130885. }
  130886. },
  130887. "memctrl_I.pause_last_SB_LUT4_I1_I3_SB_CARRY_CO": {
  130888. "hide_name": 0,
  130889. "type": "SB_CARRY",
  130890. "parameters": {
  130891. },
  130892. "attributes": {
  130893. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  130894. },
  130895. "port_directions": {
  130896. "CI": "input",
  130897. "CO": "output",
  130898. "I0": "input",
  130899. "I1": "input"
  130900. },
  130901. "connections": {
  130902. "CI": [ 5459 ],
  130903. "CO": [ 5458 ],
  130904. "I0": [ 5453 ],
  130905. "I1": [ "1" ]
  130906. }
  130907. },
  130908. "memctrl_I.pause_last_SB_LUT4_I1_O_SB_LUT4_O": {
  130909. "hide_name": 0,
  130910. "type": "SB_LUT4",
  130911. "parameters": {
  130912. "LUT_INIT": "0110100110010110"
  130913. },
  130914. "attributes": {
  130915. "module_not_derived": "00000000000000000000000000000001",
  130916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  130917. },
  130918. "port_directions": {
  130919. "I0": "input",
  130920. "I1": "input",
  130921. "I2": "input",
  130922. "I3": "input",
  130923. "O": "output"
  130924. },
  130925. "connections": {
  130926. "I0": [ "0" ],
  130927. "I1": [ 5455 ],
  130928. "I2": [ "1" ],
  130929. "I3": [ 5449 ],
  130930. "O": [ 5454 ]
  130931. }
  130932. },
  130933. "memctrl_I.pause_last_SB_LUT4_I1_O_SB_LUT4_O_1": {
  130934. "hide_name": 0,
  130935. "type": "SB_LUT4",
  130936. "parameters": {
  130937. "LUT_INIT": "0110100110010110"
  130938. },
  130939. "attributes": {
  130940. "module_not_derived": "00000000000000000000000000000001",
  130941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  130942. },
  130943. "port_directions": {
  130944. "I0": "input",
  130945. "I1": "input",
  130946. "I2": "input",
  130947. "I3": "input",
  130948. "O": "output"
  130949. },
  130950. "connections": {
  130951. "I0": [ "0" ],
  130952. "I1": [ 5453 ],
  130953. "I2": [ "1" ],
  130954. "I3": [ 5459 ],
  130955. "O": [ 5452 ]
  130956. }
  130957. },
  130958. "memctrl_I.pause_last_SB_LUT4_I1_O_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  130959. "hide_name": 0,
  130960. "type": "SB_CARRY",
  130961. "parameters": {
  130962. },
  130963. "attributes": {
  130964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  130965. },
  130966. "port_directions": {
  130967. "CI": "input",
  130968. "CO": "output",
  130969. "I0": "input",
  130970. "I1": "input"
  130971. },
  130972. "connections": {
  130973. "CI": [ 5449 ],
  130974. "CO": [ 5459 ],
  130975. "I0": [ 5455 ],
  130976. "I1": [ "1" ]
  130977. }
  130978. },
  130979. "memctrl_I.pause_last_SB_LUT4_I1_O_SB_LUT4_O_2": {
  130980. "hide_name": 0,
  130981. "type": "SB_LUT4",
  130982. "parameters": {
  130983. "LUT_INIT": "0000000011111111"
  130984. },
  130985. "attributes": {
  130986. "module_not_derived": "00000000000000000000000000000001",
  130987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  130988. },
  130989. "port_directions": {
  130990. "I0": "input",
  130991. "I1": "input",
  130992. "I2": "input",
  130993. "I3": "input",
  130994. "O": "output"
  130995. },
  130996. "connections": {
  130997. "I0": [ "0" ],
  130998. "I1": [ "0" ],
  130999. "I2": [ "0" ],
  131000. "I3": [ 5449 ],
  131001. "O": [ 5448 ]
  131002. }
  131003. },
  131004. "memctrl_I.pause_last_SB_LUT4_I3": {
  131005. "hide_name": 0,
  131006. "type": "SB_LUT4",
  131007. "parameters": {
  131008. "LUT_INIT": "0000001100110011"
  131009. },
  131010. "attributes": {
  131011. "module_not_derived": "00000000000000000000000000000001",
  131012. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131013. },
  131014. "port_directions": {
  131015. "I0": "input",
  131016. "I1": "input",
  131017. "I2": "input",
  131018. "I3": "input",
  131019. "O": "output"
  131020. },
  131021. "connections": {
  131022. "I0": [ "0" ],
  131023. "I1": [ 127 ],
  131024. "I2": [ 5451 ],
  131025. "I3": [ 5457 ],
  131026. "O": [ 5460 ]
  131027. }
  131028. },
  131029. "memctrl_I.pause_last_SB_LUT4_I3_1": {
  131030. "hide_name": 0,
  131031. "type": "SB_LUT4",
  131032. "parameters": {
  131033. "LUT_INIT": "1011101100001011"
  131034. },
  131035. "attributes": {
  131036. "module_not_derived": "00000000000000000000000000000001",
  131037. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131038. },
  131039. "port_directions": {
  131040. "I0": "input",
  131041. "I1": "input",
  131042. "I2": "input",
  131043. "I3": "input",
  131044. "O": "output"
  131045. },
  131046. "connections": {
  131047. "I0": [ 5461 ],
  131048. "I1": [ 5462 ],
  131049. "I2": [ 5451 ],
  131050. "I3": [ 5457 ],
  131051. "O": [ 5463 ]
  131052. }
  131053. },
  131054. "memctrl_I.pause_last_SB_LUT4_I3_1_O_SB_LUT4_O": {
  131055. "hide_name": 0,
  131056. "type": "SB_LUT4",
  131057. "parameters": {
  131058. "LUT_INIT": "0000000000001111"
  131059. },
  131060. "attributes": {
  131061. "module_not_derived": "00000000000000000000000000000001",
  131062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  131063. },
  131064. "port_directions": {
  131065. "I0": "input",
  131066. "I1": "input",
  131067. "I2": "input",
  131068. "I3": "input",
  131069. "O": "output"
  131070. },
  131071. "connections": {
  131072. "I0": [ "0" ],
  131073. "I1": [ "0" ],
  131074. "I2": [ 5423 ],
  131075. "I3": [ 5386 ],
  131076. "O": [ 5464 ]
  131077. }
  131078. },
  131079. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2": {
  131080. "hide_name": 0,
  131081. "type": "SB_LUT4",
  131082. "parameters": {
  131083. "LUT_INIT": "0100111100001111"
  131084. },
  131085. "attributes": {
  131086. "module_not_derived": "00000000000000000000000000000001",
  131087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131088. },
  131089. "port_directions": {
  131090. "I0": "input",
  131091. "I1": "input",
  131092. "I2": "input",
  131093. "I3": "input",
  131094. "O": "output"
  131095. },
  131096. "connections": {
  131097. "I0": [ 5423 ],
  131098. "I1": [ 133 ],
  131099. "I2": [ 5460 ],
  131100. "I3": [ 5465 ],
  131101. "O": [ 639 ]
  131102. }
  131103. },
  131104. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O": {
  131105. "hide_name": 0,
  131106. "type": "SB_LUT4",
  131107. "parameters": {
  131108. "LUT_INIT": "1111111100000100"
  131109. },
  131110. "attributes": {
  131111. "module_not_derived": "00000000000000000000000000000001",
  131112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131113. },
  131114. "port_directions": {
  131115. "I0": "input",
  131116. "I1": "input",
  131117. "I2": "input",
  131118. "I3": "input",
  131119. "O": "output"
  131120. },
  131121. "connections": {
  131122. "I0": [ 127 ],
  131123. "I1": [ 5393 ],
  131124. "I2": [ 5424 ],
  131125. "I3": [ 5466 ],
  131126. "O": [ 5467 ]
  131127. }
  131128. },
  131129. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_1": {
  131130. "hide_name": 0,
  131131. "type": "SB_LUT4",
  131132. "parameters": {
  131133. "LUT_INIT": "1111111101000000"
  131134. },
  131135. "attributes": {
  131136. "module_not_derived": "00000000000000000000000000000001",
  131137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131138. },
  131139. "port_directions": {
  131140. "I0": "input",
  131141. "I1": "input",
  131142. "I2": "input",
  131143. "I3": "input",
  131144. "O": "output"
  131145. },
  131146. "connections": {
  131147. "I0": [ 127 ],
  131148. "I1": [ 133 ],
  131149. "I2": [ 647 ],
  131150. "I3": [ 5468 ],
  131151. "O": [ 5469 ]
  131152. }
  131153. },
  131154. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_1_I3_SB_LUT4_O": {
  131155. "hide_name": 0,
  131156. "type": "SB_LUT4",
  131157. "parameters": {
  131158. "LUT_INIT": "0001000001010000"
  131159. },
  131160. "attributes": {
  131161. "module_not_derived": "00000000000000000000000000000001",
  131162. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131163. },
  131164. "port_directions": {
  131165. "I0": "input",
  131166. "I1": "input",
  131167. "I2": "input",
  131168. "I3": "input",
  131169. "O": "output"
  131170. },
  131171. "connections": {
  131172. "I0": [ 127 ],
  131173. "I1": [ 120 ],
  131174. "I2": [ 5394 ],
  131175. "I3": [ 5390 ],
  131176. "O": [ 5468 ]
  131177. }
  131178. },
  131179. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_2": {
  131180. "hide_name": 0,
  131181. "type": "SB_LUT4",
  131182. "parameters": {
  131183. "LUT_INIT": "0101010101000000"
  131184. },
  131185. "attributes": {
  131186. "module_not_derived": "00000000000000000000000000000001",
  131187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131188. },
  131189. "port_directions": {
  131190. "I0": "input",
  131191. "I1": "input",
  131192. "I2": "input",
  131193. "I3": "input",
  131194. "O": "output"
  131195. },
  131196. "connections": {
  131197. "I0": [ 127 ],
  131198. "I1": [ 5393 ],
  131199. "I2": [ 5424 ],
  131200. "I3": [ 463 ],
  131201. "O": [ 5470 ]
  131202. }
  131203. },
  131204. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_3": {
  131205. "hide_name": 0,
  131206. "type": "SB_LUT4",
  131207. "parameters": {
  131208. "LUT_INIT": "0011001100100000"
  131209. },
  131210. "attributes": {
  131211. "module_not_derived": "00000000000000000000000000000001",
  131212. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131213. },
  131214. "port_directions": {
  131215. "I0": "input",
  131216. "I1": "input",
  131217. "I2": "input",
  131218. "I3": "input",
  131219. "O": "output"
  131220. },
  131221. "connections": {
  131222. "I0": [ 5461 ],
  131223. "I1": [ 127 ],
  131224. "I2": [ 5462 ],
  131225. "I3": [ 5471 ],
  131226. "O": [ 5472 ]
  131227. }
  131228. },
  131229. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_3_I3_SB_LUT4_O": {
  131230. "hide_name": 0,
  131231. "type": "SB_LUT4",
  131232. "parameters": {
  131233. "LUT_INIT": "1010100000000000"
  131234. },
  131235. "attributes": {
  131236. "module_not_derived": "00000000000000000000000000000001",
  131237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131238. },
  131239. "port_directions": {
  131240. "I0": "input",
  131241. "I1": "input",
  131242. "I2": "input",
  131243. "I3": "input",
  131244. "O": "output"
  131245. },
  131246. "connections": {
  131247. "I0": [ 120 ],
  131248. "I1": [ 5394 ],
  131249. "I2": [ 5395 ],
  131250. "I3": [ 5390 ],
  131251. "O": [ 5471 ]
  131252. }
  131253. },
  131254. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_4": {
  131255. "hide_name": 0,
  131256. "type": "SB_LUT4",
  131257. "parameters": {
  131258. "LUT_INIT": "0011001100000010"
  131259. },
  131260. "attributes": {
  131261. "module_not_derived": "00000000000000000000000000000001",
  131262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131263. },
  131264. "port_directions": {
  131265. "I0": "input",
  131266. "I1": "input",
  131267. "I2": "input",
  131268. "I3": "input",
  131269. "O": "output"
  131270. },
  131271. "connections": {
  131272. "I0": [ 5389 ],
  131273. "I1": [ 127 ],
  131274. "I2": [ 5464 ],
  131275. "I3": [ 5473 ],
  131276. "O": [ 5416 ]
  131277. }
  131278. },
  131279. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_4_I3_SB_LUT4_O": {
  131280. "hide_name": 0,
  131281. "type": "SB_LUT4",
  131282. "parameters": {
  131283. "LUT_INIT": "1100000000000000"
  131284. },
  131285. "attributes": {
  131286. "module_not_derived": "00000000000000000000000000000001",
  131287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131288. },
  131289. "port_directions": {
  131290. "I0": "input",
  131291. "I1": "input",
  131292. "I2": "input",
  131293. "I3": "input",
  131294. "O": "output"
  131295. },
  131296. "connections": {
  131297. "I0": [ "0" ],
  131298. "I1": [ 5423 ],
  131299. "I2": [ 133 ],
  131300. "I3": [ 5465 ],
  131301. "O": [ 5473 ]
  131302. }
  131303. },
  131304. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_5": {
  131305. "hide_name": 0,
  131306. "type": "SB_LUT4",
  131307. "parameters": {
  131308. "LUT_INIT": "0010000000110011"
  131309. },
  131310. "attributes": {
  131311. "module_not_derived": "00000000000000000000000000000001",
  131312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131313. },
  131314. "port_directions": {
  131315. "I0": "input",
  131316. "I1": "input",
  131317. "I2": "input",
  131318. "I3": "input",
  131319. "O": "output"
  131320. },
  131321. "connections": {
  131322. "I0": [ 5389 ],
  131323. "I1": [ 127 ],
  131324. "I2": [ 5464 ],
  131325. "I3": [ 5463 ],
  131326. "O": [ 5474 ]
  131327. }
  131328. },
  131329. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O": {
  131330. "hide_name": 0,
  131331. "type": "SB_LUT4",
  131332. "parameters": {
  131333. "LUT_INIT": "0001000001010000"
  131334. },
  131335. "attributes": {
  131336. "module_not_derived": "00000000000000000000000000000001",
  131337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131338. },
  131339. "port_directions": {
  131340. "I0": "input",
  131341. "I1": "input",
  131342. "I2": "input",
  131343. "I3": "input",
  131344. "O": "output"
  131345. },
  131346. "connections": {
  131347. "I0": [ 127 ],
  131348. "I1": [ 120 ],
  131349. "I2": [ 5395 ],
  131350. "I3": [ 5390 ],
  131351. "O": [ 5466 ]
  131352. }
  131353. },
  131354. "memctrl_I.phy_cs_o_SB_DFFSS_Q": {
  131355. "hide_name": 0,
  131356. "type": "SB_DFFSS",
  131357. "parameters": {
  131358. },
  131359. "attributes": {
  131360. "module_not_derived": "00000000000000000000000000000001",
  131361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:615.4-637.8|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  131362. },
  131363. "port_directions": {
  131364. "C": "input",
  131365. "D": "input",
  131366. "Q": "output",
  131367. "S": "input"
  131368. },
  131369. "connections": {
  131370. "C": [ 42 ],
  131371. "D": [ 5475 ],
  131372. "Q": [ 5476 ],
  131373. "S": [ 127 ]
  131374. }
  131375. },
  131376. "memctrl_I.phy_cs_o_SB_DFFSS_Q_1": {
  131377. "hide_name": 0,
  131378. "type": "SB_DFFSS",
  131379. "parameters": {
  131380. },
  131381. "attributes": {
  131382. "module_not_derived": "00000000000000000000000000000001",
  131383. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:615.4-637.8|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  131384. },
  131385. "port_directions": {
  131386. "C": "input",
  131387. "D": "input",
  131388. "Q": "output",
  131389. "S": "input"
  131390. },
  131391. "connections": {
  131392. "C": [ 42 ],
  131393. "D": [ 5477 ],
  131394. "Q": [ 5478 ],
  131395. "S": [ 127 ]
  131396. }
  131397. },
  131398. "memctrl_I.phy_cs_o_SB_DFFSS_Q_1_D_SB_LUT4_O": {
  131399. "hide_name": 0,
  131400. "type": "SB_LUT4",
  131401. "parameters": {
  131402. "LUT_INIT": "0000000011111100"
  131403. },
  131404. "attributes": {
  131405. "module_not_derived": "00000000000000000000000000000001",
  131406. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131407. },
  131408. "port_directions": {
  131409. "I0": "input",
  131410. "I1": "input",
  131411. "I2": "input",
  131412. "I3": "input",
  131413. "O": "output"
  131414. },
  131415. "connections": {
  131416. "I0": [ "0" ],
  131417. "I1": [ 5478 ],
  131418. "I2": [ 5479 ],
  131419. "I3": [ 5480 ],
  131420. "O": [ 5477 ]
  131421. }
  131422. },
  131423. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O": {
  131424. "hide_name": 0,
  131425. "type": "SB_LUT4",
  131426. "parameters": {
  131427. "LUT_INIT": "0000000011111100"
  131428. },
  131429. "attributes": {
  131430. "module_not_derived": "00000000000000000000000000000001",
  131431. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131432. },
  131433. "port_directions": {
  131434. "I0": "input",
  131435. "I1": "input",
  131436. "I2": "input",
  131437. "I3": "input",
  131438. "O": "output"
  131439. },
  131440. "connections": {
  131441. "I0": [ "0" ],
  131442. "I1": [ 5476 ],
  131443. "I2": [ 5479 ],
  131444. "I3": [ 5481 ],
  131445. "O": [ 5475 ]
  131446. }
  131447. },
  131448. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  131449. "hide_name": 0,
  131450. "type": "SB_LUT4",
  131451. "parameters": {
  131452. "LUT_INIT": "1000110010000000"
  131453. },
  131454. "attributes": {
  131455. "module_not_derived": "00000000000000000000000000000001",
  131456. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131457. },
  131458. "port_directions": {
  131459. "I0": "input",
  131460. "I1": "input",
  131461. "I2": "input",
  131462. "I3": "input",
  131463. "O": "output"
  131464. },
  131465. "connections": {
  131466. "I0": [ 5482 ],
  131467. "I1": [ 5483 ],
  131468. "I2": [ 5465 ],
  131469. "I3": [ 5484 ],
  131470. "O": [ 5481 ]
  131471. }
  131472. },
  131473. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O": {
  131474. "hide_name": 0,
  131475. "type": "SB_LUT4",
  131476. "parameters": {
  131477. "LUT_INIT": "1100000000000000"
  131478. },
  131479. "attributes": {
  131480. "module_not_derived": "00000000000000000000000000000001",
  131481. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131482. },
  131483. "port_directions": {
  131484. "I0": "input",
  131485. "I1": "input",
  131486. "I2": "input",
  131487. "I3": "input",
  131488. "O": "output"
  131489. },
  131490. "connections": {
  131491. "I0": [ "0" ],
  131492. "I1": [ 5413 ],
  131493. "I2": [ 5423 ],
  131494. "I3": [ 5485 ],
  131495. "O": [ 5482 ]
  131496. }
  131497. },
  131498. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O": {
  131499. "hide_name": 0,
  131500. "type": "SB_LUT4",
  131501. "parameters": {
  131502. "LUT_INIT": "0110100110010110"
  131503. },
  131504. "attributes": {
  131505. "module_not_derived": "00000000000000000000000000000001",
  131506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  131507. },
  131508. "port_directions": {
  131509. "I0": "input",
  131510. "I1": "input",
  131511. "I2": "input",
  131512. "I3": "input",
  131513. "O": "output"
  131514. },
  131515. "connections": {
  131516. "I0": [ "0" ],
  131517. "I1": [ "0" ],
  131518. "I2": [ 5486 ],
  131519. "I3": [ 5487 ],
  131520. "O": [ 5485 ]
  131521. }
  131522. },
  131523. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  131524. "hide_name": 0,
  131525. "type": "SB_LUT4",
  131526. "parameters": {
  131527. "LUT_INIT": "0000000011111111"
  131528. },
  131529. "attributes": {
  131530. "module_not_derived": "00000000000000000000000000000001",
  131531. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  131532. },
  131533. "port_directions": {
  131534. "I0": "input",
  131535. "I1": "input",
  131536. "I2": "input",
  131537. "I3": "input",
  131538. "O": "output"
  131539. },
  131540. "connections": {
  131541. "I0": [ "0" ],
  131542. "I1": [ "0" ],
  131543. "I2": [ "0" ],
  131544. "I3": [ 5411 ],
  131545. "O": [ 5486 ]
  131546. }
  131547. },
  131548. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_CARRY_CI": {
  131549. "hide_name": 0,
  131550. "type": "SB_CARRY",
  131551. "parameters": {
  131552. },
  131553. "attributes": {
  131554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  131555. },
  131556. "port_directions": {
  131557. "CI": "input",
  131558. "CO": "output",
  131559. "I0": "input",
  131560. "I1": "input"
  131561. },
  131562. "connections": {
  131563. "CI": [ 5487 ],
  131564. "CO": [ 5488 ],
  131565. "I0": [ "0" ],
  131566. "I1": [ 5486 ]
  131567. }
  131568. },
  131569. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3": {
  131570. "hide_name": 0,
  131571. "type": "SB_LUT4",
  131572. "parameters": {
  131573. "LUT_INIT": "1111000000000000"
  131574. },
  131575. "attributes": {
  131576. "module_not_derived": "00000000000000000000000000000001",
  131577. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  131578. },
  131579. "port_directions": {
  131580. "I0": "input",
  131581. "I1": "input",
  131582. "I2": "input",
  131583. "I3": "input",
  131584. "O": "output"
  131585. },
  131586. "connections": {
  131587. "I0": [ "0" ],
  131588. "I1": [ "0" ],
  131589. "I2": [ 5423 ],
  131590. "I3": [ 5488 ],
  131591. "O": [ 5489 ]
  131592. }
  131593. },
  131594. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O": {
  131595. "hide_name": 0,
  131596. "type": "SB_LUT4",
  131597. "parameters": {
  131598. "LUT_INIT": "0000000000001100"
  131599. },
  131600. "attributes": {
  131601. "module_not_derived": "00000000000000000000000000000001",
  131602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131603. },
  131604. "port_directions": {
  131605. "I0": "input",
  131606. "I1": "input",
  131607. "I2": "input",
  131608. "I3": "input",
  131609. "O": "output"
  131610. },
  131611. "connections": {
  131612. "I0": [ "0" ],
  131613. "I1": [ 133 ],
  131614. "I2": [ 5462 ],
  131615. "I3": [ 5451 ],
  131616. "O": [ 5483 ]
  131617. }
  131618. },
  131619. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  131620. "hide_name": 0,
  131621. "type": "SB_LUT4",
  131622. "parameters": {
  131623. "LUT_INIT": "0000000011111111"
  131624. },
  131625. "attributes": {
  131626. "module_not_derived": "00000000000000000000000000000001",
  131627. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  131628. },
  131629. "port_directions": {
  131630. "I0": "input",
  131631. "I1": "input",
  131632. "I2": "input",
  131633. "I3": "input",
  131634. "O": "output"
  131635. },
  131636. "connections": {
  131637. "I0": [ "0" ],
  131638. "I1": [ "0" ],
  131639. "I2": [ "0" ],
  131640. "I3": [ 5413 ],
  131641. "O": [ 5487 ]
  131642. }
  131643. },
  131644. "memctrl_I.rf_overflow_SB_DFF_Q": {
  131645. "hide_name": 0,
  131646. "type": "SB_DFF",
  131647. "parameters": {
  131648. },
  131649. "attributes": {
  131650. "module_not_derived": "00000000000000000000000000000001",
  131651. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:447.2-448.73|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  131652. },
  131653. "port_directions": {
  131654. "C": "input",
  131655. "D": "input",
  131656. "Q": "output"
  131657. },
  131658. "connections": {
  131659. "C": [ 42 ],
  131660. "D": [ 5490 ],
  131661. "Q": [ 5491 ]
  131662. }
  131663. },
  131664. "memctrl_I.rf_overflow_SB_LUT4_I1": {
  131665. "hide_name": 0,
  131666. "type": "SB_LUT4",
  131667. "parameters": {
  131668. "LUT_INIT": "1111110000001100"
  131669. },
  131670. "attributes": {
  131671. "module_not_derived": "00000000000000000000000000000001",
  131672. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131673. },
  131674. "port_directions": {
  131675. "I0": "input",
  131676. "I1": "input",
  131677. "I2": "input",
  131678. "I3": "input",
  131679. "O": "output"
  131680. },
  131681. "connections": {
  131682. "I0": [ "0" ],
  131683. "I1": [ 5491 ],
  131684. "I2": [ 704 ],
  131685. "I3": [ 5492 ],
  131686. "O": [ 5493 ]
  131687. }
  131688. },
  131689. "memctrl_I.rf_overflow_SB_LUT4_I1_I3_SB_DFFER_Q": {
  131690. "hide_name": 0,
  131691. "type": "SB_DFFER",
  131692. "parameters": {
  131693. },
  131694. "attributes": {
  131695. "module_not_derived": "00000000000000000000000000000001",
  131696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  131697. },
  131698. "port_directions": {
  131699. "C": "input",
  131700. "D": "input",
  131701. "E": "input",
  131702. "Q": "output",
  131703. "R": "input"
  131704. },
  131705. "connections": {
  131706. "C": [ 42 ],
  131707. "D": [ 276 ],
  131708. "E": [ 644 ],
  131709. "Q": [ 5492 ],
  131710. "R": [ 127 ]
  131711. }
  131712. },
  131713. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O": {
  131714. "hide_name": 0,
  131715. "type": "SB_LUT4",
  131716. "parameters": {
  131717. "LUT_INIT": "1100000011110011"
  131718. },
  131719. "attributes": {
  131720. "module_not_derived": "00000000000000000000000000000001",
  131721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131722. },
  131723. "port_directions": {
  131724. "I0": "input",
  131725. "I1": "input",
  131726. "I2": "input",
  131727. "I3": "input",
  131728. "O": "output"
  131729. },
  131730. "connections": {
  131731. "I0": [ "0" ],
  131732. "I1": [ 704 ],
  131733. "I2": [ 5494 ],
  131734. "I3": [ 5386 ],
  131735. "O": [ 5495 ]
  131736. }
  131737. },
  131738. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_1": {
  131739. "hide_name": 0,
  131740. "type": "SB_LUT4",
  131741. "parameters": {
  131742. "LUT_INIT": "1100000011110011"
  131743. },
  131744. "attributes": {
  131745. "module_not_derived": "00000000000000000000000000000001",
  131746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131747. },
  131748. "port_directions": {
  131749. "I0": "input",
  131750. "I1": "input",
  131751. "I2": "input",
  131752. "I3": "input",
  131753. "O": "output"
  131754. },
  131755. "connections": {
  131756. "I0": [ "0" ],
  131757. "I1": [ 704 ],
  131758. "I2": [ 5496 ],
  131759. "I3": [ 645 ],
  131760. "O": [ 5497 ]
  131761. }
  131762. },
  131763. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_1_I2_SB_DFFER_Q": {
  131764. "hide_name": 0,
  131765. "type": "SB_DFFER",
  131766. "parameters": {
  131767. },
  131768. "attributes": {
  131769. "module_not_derived": "00000000000000000000000000000001",
  131770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  131771. },
  131772. "port_directions": {
  131773. "C": "input",
  131774. "D": "input",
  131775. "E": "input",
  131776. "Q": "output",
  131777. "R": "input"
  131778. },
  131779. "connections": {
  131780. "C": [ 42 ],
  131781. "D": [ 274 ],
  131782. "E": [ 644 ],
  131783. "Q": [ 5496 ],
  131784. "R": [ 127 ]
  131785. }
  131786. },
  131787. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_2": {
  131788. "hide_name": 0,
  131789. "type": "SB_LUT4",
  131790. "parameters": {
  131791. "LUT_INIT": "1111110000001100"
  131792. },
  131793. "attributes": {
  131794. "module_not_derived": "00000000000000000000000000000001",
  131795. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131796. },
  131797. "port_directions": {
  131798. "I0": "input",
  131799. "I1": "input",
  131800. "I2": "input",
  131801. "I3": "input",
  131802. "O": "output"
  131803. },
  131804. "connections": {
  131805. "I0": [ "0" ],
  131806. "I1": [ 5411 ],
  131807. "I2": [ 704 ],
  131808. "I3": [ 5498 ],
  131809. "O": [ 5499 ]
  131810. }
  131811. },
  131812. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_2_I3_SB_DFFER_Q": {
  131813. "hide_name": 0,
  131814. "type": "SB_DFFER",
  131815. "parameters": {
  131816. },
  131817. "attributes": {
  131818. "module_not_derived": "00000000000000000000000000000001",
  131819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  131820. },
  131821. "port_directions": {
  131822. "C": "input",
  131823. "D": "input",
  131824. "E": "input",
  131825. "Q": "output",
  131826. "R": "input"
  131827. },
  131828. "connections": {
  131829. "C": [ 42 ],
  131830. "D": [ 272 ],
  131831. "E": [ 644 ],
  131832. "Q": [ 5498 ],
  131833. "R": [ 127 ]
  131834. }
  131835. },
  131836. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_3": {
  131837. "hide_name": 0,
  131838. "type": "SB_LUT4",
  131839. "parameters": {
  131840. "LUT_INIT": "1111110000001100"
  131841. },
  131842. "attributes": {
  131843. "module_not_derived": "00000000000000000000000000000001",
  131844. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131845. },
  131846. "port_directions": {
  131847. "I0": "input",
  131848. "I1": "input",
  131849. "I2": "input",
  131850. "I3": "input",
  131851. "O": "output"
  131852. },
  131853. "connections": {
  131854. "I0": [ "0" ],
  131855. "I1": [ 5413 ],
  131856. "I2": [ 704 ],
  131857. "I3": [ 5500 ],
  131858. "O": [ 5501 ]
  131859. }
  131860. },
  131861. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_3_I3_SB_DFFER_Q": {
  131862. "hide_name": 0,
  131863. "type": "SB_DFFER",
  131864. "parameters": {
  131865. },
  131866. "attributes": {
  131867. "module_not_derived": "00000000000000000000000000000001",
  131868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  131869. },
  131870. "port_directions": {
  131871. "C": "input",
  131872. "D": "input",
  131873. "E": "input",
  131874. "Q": "output",
  131875. "R": "input"
  131876. },
  131877. "connections": {
  131878. "C": [ 42 ],
  131879. "D": [ 273 ],
  131880. "E": [ 644 ],
  131881. "Q": [ 5500 ],
  131882. "R": [ 127 ]
  131883. }
  131884. },
  131885. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_4": {
  131886. "hide_name": 0,
  131887. "type": "SB_LUT4",
  131888. "parameters": {
  131889. "LUT_INIT": "1111110000001100"
  131890. },
  131891. "attributes": {
  131892. "module_not_derived": "00000000000000000000000000000001",
  131893. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131894. },
  131895. "port_directions": {
  131896. "I0": "input",
  131897. "I1": "input",
  131898. "I2": "input",
  131899. "I3": "input",
  131900. "O": "output"
  131901. },
  131902. "connections": {
  131903. "I0": [ "0" ],
  131904. "I1": [ 5389 ],
  131905. "I2": [ 704 ],
  131906. "I3": [ 5502 ],
  131907. "O": [ 5503 ]
  131908. }
  131909. },
  131910. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_4_I3_SB_DFFER_Q": {
  131911. "hide_name": 0,
  131912. "type": "SB_DFFER",
  131913. "parameters": {
  131914. },
  131915. "attributes": {
  131916. "module_not_derived": "00000000000000000000000000000001",
  131917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  131918. },
  131919. "port_directions": {
  131920. "C": "input",
  131921. "D": "input",
  131922. "E": "input",
  131923. "Q": "output",
  131924. "R": "input"
  131925. },
  131926. "connections": {
  131927. "C": [ 42 ],
  131928. "D": [ 216 ],
  131929. "E": [ 644 ],
  131930. "Q": [ 5502 ],
  131931. "R": [ 127 ]
  131932. }
  131933. },
  131934. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_5": {
  131935. "hide_name": 0,
  131936. "type": "SB_LUT4",
  131937. "parameters": {
  131938. "LUT_INIT": "1111110000001100"
  131939. },
  131940. "attributes": {
  131941. "module_not_derived": "00000000000000000000000000000001",
  131942. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131943. },
  131944. "port_directions": {
  131945. "I0": "input",
  131946. "I1": "input",
  131947. "I2": "input",
  131948. "I3": "input",
  131949. "O": "output"
  131950. },
  131951. "connections": {
  131952. "I0": [ "0" ],
  131953. "I1": [ 5423 ],
  131954. "I2": [ 704 ],
  131955. "I3": [ 5504 ],
  131956. "O": [ 5505 ]
  131957. }
  131958. },
  131959. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_5_I3_SB_DFFER_Q": {
  131960. "hide_name": 0,
  131961. "type": "SB_DFFER",
  131962. "parameters": {
  131963. },
  131964. "attributes": {
  131965. "module_not_derived": "00000000000000000000000000000001",
  131966. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  131967. },
  131968. "port_directions": {
  131969. "C": "input",
  131970. "D": "input",
  131971. "E": "input",
  131972. "Q": "output",
  131973. "R": "input"
  131974. },
  131975. "connections": {
  131976. "C": [ 42 ],
  131977. "D": [ 217 ],
  131978. "E": [ 644 ],
  131979. "Q": [ 5504 ],
  131980. "R": [ 127 ]
  131981. }
  131982. },
  131983. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_6": {
  131984. "hide_name": 0,
  131985. "type": "SB_LUT4",
  131986. "parameters": {
  131987. "LUT_INIT": "1111001111000000"
  131988. },
  131989. "attributes": {
  131990. "module_not_derived": "00000000000000000000000000000001",
  131991. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  131992. },
  131993. "port_directions": {
  131994. "I0": "input",
  131995. "I1": "input",
  131996. "I2": "input",
  131997. "I3": "input",
  131998. "O": "output"
  131999. },
  132000. "connections": {
  132001. "I0": [ "0" ],
  132002. "I1": [ 704 ],
  132003. "I2": [ 5506 ],
  132004. "I3": [ 645 ],
  132005. "O": [ 5507 ]
  132006. }
  132007. },
  132008. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_6_I2_SB_DFFER_Q": {
  132009. "hide_name": 0,
  132010. "type": "SB_DFFER",
  132011. "parameters": {
  132012. },
  132013. "attributes": {
  132014. "module_not_derived": "00000000000000000000000000000001",
  132015. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  132016. },
  132017. "port_directions": {
  132018. "C": "input",
  132019. "D": "input",
  132020. "E": "input",
  132021. "Q": "output",
  132022. "R": "input"
  132023. },
  132024. "connections": {
  132025. "C": [ 42 ],
  132026. "D": [ 275 ],
  132027. "E": [ 644 ],
  132028. "Q": [ 5506 ],
  132029. "R": [ 127 ]
  132030. }
  132031. },
  132032. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_7": {
  132033. "hide_name": 0,
  132034. "type": "SB_LUT4",
  132035. "parameters": {
  132036. "LUT_INIT": "1111001111000000"
  132037. },
  132038. "attributes": {
  132039. "module_not_derived": "00000000000000000000000000000001",
  132040. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  132041. },
  132042. "port_directions": {
  132043. "I0": "input",
  132044. "I1": "input",
  132045. "I2": "input",
  132046. "I3": "input",
  132047. "O": "output"
  132048. },
  132049. "connections": {
  132050. "I0": [ "0" ],
  132051. "I1": [ 704 ],
  132052. "I2": [ 5508 ],
  132053. "I3": [ 5386 ],
  132054. "O": [ 5509 ]
  132055. }
  132056. },
  132057. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_7_I2_SB_DFFER_Q": {
  132058. "hide_name": 0,
  132059. "type": "SB_DFFER",
  132060. "parameters": {
  132061. },
  132062. "attributes": {
  132063. "module_not_derived": "00000000000000000000000000000001",
  132064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  132065. },
  132066. "port_directions": {
  132067. "C": "input",
  132068. "D": "input",
  132069. "E": "input",
  132070. "Q": "output",
  132071. "R": "input"
  132072. },
  132073. "connections": {
  132074. "C": [ 42 ],
  132075. "D": [ 220 ],
  132076. "E": [ 644 ],
  132077. "Q": [ 5508 ],
  132078. "R": [ 127 ]
  132079. }
  132080. },
  132081. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_8": {
  132082. "hide_name": 0,
  132083. "type": "SB_LUT4",
  132084. "parameters": {
  132085. "LUT_INIT": "1111110000110000"
  132086. },
  132087. "attributes": {
  132088. "module_not_derived": "00000000000000000000000000000001",
  132089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  132090. },
  132091. "port_directions": {
  132092. "I0": "input",
  132093. "I1": "input",
  132094. "I2": "input",
  132095. "I3": "input",
  132096. "O": "output"
  132097. },
  132098. "connections": {
  132099. "I0": [ "0" ],
  132100. "I1": [ 704 ],
  132101. "I2": [ 133 ],
  132102. "I3": [ 5510 ],
  132103. "O": [ 5511 ]
  132104. }
  132105. },
  132106. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_8_I3_SB_DFFER_Q": {
  132107. "hide_name": 0,
  132108. "type": "SB_DFFER",
  132109. "parameters": {
  132110. },
  132111. "attributes": {
  132112. "module_not_derived": "00000000000000000000000000000001",
  132113. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  132114. },
  132115. "port_directions": {
  132116. "C": "input",
  132117. "D": "input",
  132118. "E": "input",
  132119. "Q": "output",
  132120. "R": "input"
  132121. },
  132122. "connections": {
  132123. "C": [ 42 ],
  132124. "D": [ 218 ],
  132125. "E": [ 644 ],
  132126. "Q": [ 5510 ],
  132127. "R": [ 127 ]
  132128. }
  132129. },
  132130. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_I2_SB_DFFER_Q": {
  132131. "hide_name": 0,
  132132. "type": "SB_DFFER",
  132133. "parameters": {
  132134. },
  132135. "attributes": {
  132136. "module_not_derived": "00000000000000000000000000000001",
  132137. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  132138. },
  132139. "port_directions": {
  132140. "C": "input",
  132141. "D": "input",
  132142. "E": "input",
  132143. "Q": "output",
  132144. "R": "input"
  132145. },
  132146. "connections": {
  132147. "C": [ 42 ],
  132148. "D": [ 219 ],
  132149. "E": [ 644 ],
  132150. "Q": [ 5494 ],
  132151. "R": [ 127 ]
  132152. }
  132153. },
  132154. "memctrl_I.rf_overflow_clr_SB_DFF_Q": {
  132155. "hide_name": 0,
  132156. "type": "SB_DFF",
  132157. "parameters": {
  132158. },
  132159. "attributes": {
  132160. "module_not_derived": "00000000000000000000000000000001",
  132161. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:344.2-345.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132162. },
  132163. "port_directions": {
  132164. "C": "input",
  132165. "D": "input",
  132166. "Q": "output"
  132167. },
  132168. "connections": {
  132169. "C": [ 42 ],
  132170. "D": [ 5512 ],
  132171. "Q": [ 5513 ]
  132172. }
  132173. },
  132174. "memctrl_I.rf_overflow_clr_SB_DFF_Q_D_SB_LUT4_O": {
  132175. "hide_name": 0,
  132176. "type": "SB_LUT4",
  132177. "parameters": {
  132178. "LUT_INIT": "1111000000000000"
  132179. },
  132180. "attributes": {
  132181. "module_not_derived": "00000000000000000000000000000001",
  132182. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  132183. },
  132184. "port_directions": {
  132185. "I0": "input",
  132186. "I1": "input",
  132187. "I2": "input",
  132188. "I3": "input",
  132189. "O": "output"
  132190. },
  132191. "connections": {
  132192. "I0": [ "0" ],
  132193. "I1": [ "0" ],
  132194. "I2": [ 69 ],
  132195. "I3": [ 5414 ],
  132196. "O": [ 5512 ]
  132197. }
  132198. },
  132199. "memctrl_I.rf_overflow_clr_SB_LUT4_I1": {
  132200. "hide_name": 0,
  132201. "type": "SB_LUT4",
  132202. "parameters": {
  132203. "LUT_INIT": "1111001000100010"
  132204. },
  132205. "attributes": {
  132206. "module_not_derived": "00000000000000000000000000000001",
  132207. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  132208. },
  132209. "port_directions": {
  132210. "I0": "input",
  132211. "I1": "input",
  132212. "I2": "input",
  132213. "I3": "input",
  132214. "O": "output"
  132215. },
  132216. "connections": {
  132217. "I0": [ 5491 ],
  132218. "I1": [ 5513 ],
  132219. "I2": [ 645 ],
  132220. "I3": [ 642 ],
  132221. "O": [ 5490 ]
  132222. }
  132223. },
  132224. "memctrl_I.rf_rden_arm_SB_DFF_Q": {
  132225. "hide_name": 0,
  132226. "type": "SB_DFF",
  132227. "parameters": {
  132228. },
  132229. "attributes": {
  132230. "module_not_derived": "00000000000000000000000000000001",
  132231. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:363.2-364.50|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132232. },
  132233. "port_directions": {
  132234. "C": "input",
  132235. "D": "input",
  132236. "Q": "output"
  132237. },
  132238. "connections": {
  132239. "C": [ 42 ],
  132240. "D": [ 5514 ],
  132241. "Q": [ 5515 ]
  132242. }
  132243. },
  132244. "memctrl_I.rf_rden_arm_SB_DFF_Q_D_SB_LUT4_O": {
  132245. "hide_name": 0,
  132246. "type": "SB_LUT4",
  132247. "parameters": {
  132248. "LUT_INIT": "0000110000000000"
  132249. },
  132250. "attributes": {
  132251. "module_not_derived": "00000000000000000000000000000001",
  132252. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  132253. },
  132254. "port_directions": {
  132255. "I0": "input",
  132256. "I1": "input",
  132257. "I2": "input",
  132258. "I3": "input",
  132259. "O": "output"
  132260. },
  132261. "connections": {
  132262. "I0": [ "0" ],
  132263. "I1": [ 704 ],
  132264. "I2": [ 469 ],
  132265. "I3": [ 645 ],
  132266. "O": [ 5514 ]
  132267. }
  132268. },
  132269. "memctrl_I.rf_rden_arm_SB_LUT4_I3": {
  132270. "hide_name": 0,
  132271. "type": "SB_LUT4",
  132272. "parameters": {
  132273. "LUT_INIT": "0000111111111111"
  132274. },
  132275. "attributes": {
  132276. "module_not_derived": "00000000000000000000000000000001",
  132277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  132278. },
  132279. "port_directions": {
  132280. "I0": "input",
  132281. "I1": "input",
  132282. "I2": "input",
  132283. "I3": "input",
  132284. "O": "output"
  132285. },
  132286. "connections": {
  132287. "I0": [ "0" ],
  132288. "I1": [ "0" ],
  132289. "I2": [ 5415 ],
  132290. "I3": [ 5515 ],
  132291. "O": [ 643 ]
  132292. }
  132293. },
  132294. "memctrl_I.rf_rden_arm_SB_LUT4_I3_1": {
  132295. "hide_name": 0,
  132296. "type": "SB_LUT4",
  132297. "parameters": {
  132298. "LUT_INIT": "1111000000000000"
  132299. },
  132300. "attributes": {
  132301. "module_not_derived": "00000000000000000000000000000001",
  132302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  132303. },
  132304. "port_directions": {
  132305. "I0": "input",
  132306. "I1": "input",
  132307. "I2": "input",
  132308. "I3": "input",
  132309. "O": "output"
  132310. },
  132311. "connections": {
  132312. "I0": [ "0" ],
  132313. "I1": [ "0" ],
  132314. "I2": [ 5415 ],
  132315. "I3": [ 5515 ],
  132316. "O": [ 5425 ]
  132317. }
  132318. },
  132319. "memctrl_I.si_data_n_SB_DFF_Q": {
  132320. "hide_name": 0,
  132321. "type": "SB_DFF",
  132322. "parameters": {
  132323. },
  132324. "attributes": {
  132325. "module_not_derived": "00000000000000000000000000000001",
  132326. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132327. },
  132328. "port_directions": {
  132329. "C": "input",
  132330. "D": "input",
  132331. "Q": "output"
  132332. },
  132333. "connections": {
  132334. "C": [ 42 ],
  132335. "D": [ 5516 ],
  132336. "Q": [ 267 ]
  132337. }
  132338. },
  132339. "memctrl_I.si_data_n_SB_DFF_Q_1": {
  132340. "hide_name": 0,
  132341. "type": "SB_DFF",
  132342. "parameters": {
  132343. },
  132344. "attributes": {
  132345. "module_not_derived": "00000000000000000000000000000001",
  132346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132347. },
  132348. "port_directions": {
  132349. "C": "input",
  132350. "D": "input",
  132351. "Q": "output"
  132352. },
  132353. "connections": {
  132354. "C": [ 42 ],
  132355. "D": [ 5517 ],
  132356. "Q": [ 268 ]
  132357. }
  132358. },
  132359. "memctrl_I.si_data_n_SB_DFF_Q_10": {
  132360. "hide_name": 0,
  132361. "type": "SB_DFF",
  132362. "parameters": {
  132363. },
  132364. "attributes": {
  132365. "module_not_derived": "00000000000000000000000000000001",
  132366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132367. },
  132368. "port_directions": {
  132369. "C": "input",
  132370. "D": "input",
  132371. "Q": "output"
  132372. },
  132373. "connections": {
  132374. "C": [ 42 ],
  132375. "D": [ 5518 ],
  132376. "Q": [ 265 ]
  132377. }
  132378. },
  132379. "memctrl_I.si_data_n_SB_DFF_Q_11": {
  132380. "hide_name": 0,
  132381. "type": "SB_DFF",
  132382. "parameters": {
  132383. },
  132384. "attributes": {
  132385. "module_not_derived": "00000000000000000000000000000001",
  132386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132387. },
  132388. "port_directions": {
  132389. "C": "input",
  132390. "D": "input",
  132391. "Q": "output"
  132392. },
  132393. "connections": {
  132394. "C": [ 42 ],
  132395. "D": [ 5519 ],
  132396. "Q": [ 266 ]
  132397. }
  132398. },
  132399. "memctrl_I.si_data_n_SB_DFF_Q_12": {
  132400. "hide_name": 0,
  132401. "type": "SB_DFF",
  132402. "parameters": {
  132403. },
  132404. "attributes": {
  132405. "module_not_derived": "00000000000000000000000000000001",
  132406. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132407. },
  132408. "port_directions": {
  132409. "C": "input",
  132410. "D": "input",
  132411. "Q": "output"
  132412. },
  132413. "connections": {
  132414. "C": [ 42 ],
  132415. "D": [ 5520 ],
  132416. "Q": [ 223 ]
  132417. }
  132418. },
  132419. "memctrl_I.si_data_n_SB_DFF_Q_13": {
  132420. "hide_name": 0,
  132421. "type": "SB_DFF",
  132422. "parameters": {
  132423. },
  132424. "attributes": {
  132425. "module_not_derived": "00000000000000000000000000000001",
  132426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132427. },
  132428. "port_directions": {
  132429. "C": "input",
  132430. "D": "input",
  132431. "Q": "output"
  132432. },
  132433. "connections": {
  132434. "C": [ 42 ],
  132435. "D": [ 5521 ],
  132436. "Q": [ 224 ]
  132437. }
  132438. },
  132439. "memctrl_I.si_data_n_SB_DFF_Q_14": {
  132440. "hide_name": 0,
  132441. "type": "SB_DFF",
  132442. "parameters": {
  132443. },
  132444. "attributes": {
  132445. "module_not_derived": "00000000000000000000000000000001",
  132446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132447. },
  132448. "port_directions": {
  132449. "C": "input",
  132450. "D": "input",
  132451. "Q": "output"
  132452. },
  132453. "connections": {
  132454. "C": [ 42 ],
  132455. "D": [ 5522 ],
  132456. "Q": [ 210 ]
  132457. }
  132458. },
  132459. "memctrl_I.si_data_n_SB_DFF_Q_15": {
  132460. "hide_name": 0,
  132461. "type": "SB_DFF",
  132462. "parameters": {
  132463. },
  132464. "attributes": {
  132465. "module_not_derived": "00000000000000000000000000000001",
  132466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132467. },
  132468. "port_directions": {
  132469. "C": "input",
  132470. "D": "input",
  132471. "Q": "output"
  132472. },
  132473. "connections": {
  132474. "C": [ 42 ],
  132475. "D": [ 5523 ],
  132476. "Q": [ 211 ]
  132477. }
  132478. },
  132479. "memctrl_I.si_data_n_SB_DFF_Q_16": {
  132480. "hide_name": 0,
  132481. "type": "SB_DFF",
  132482. "parameters": {
  132483. },
  132484. "attributes": {
  132485. "module_not_derived": "00000000000000000000000000000001",
  132486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132487. },
  132488. "port_directions": {
  132489. "C": "input",
  132490. "D": "input",
  132491. "Q": "output"
  132492. },
  132493. "connections": {
  132494. "C": [ 42 ],
  132495. "D": [ 5524 ],
  132496. "Q": [ 274 ]
  132497. }
  132498. },
  132499. "memctrl_I.si_data_n_SB_DFF_Q_17": {
  132500. "hide_name": 0,
  132501. "type": "SB_DFF",
  132502. "parameters": {
  132503. },
  132504. "attributes": {
  132505. "module_not_derived": "00000000000000000000000000000001",
  132506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132507. },
  132508. "port_directions": {
  132509. "C": "input",
  132510. "D": "input",
  132511. "Q": "output"
  132512. },
  132513. "connections": {
  132514. "C": [ 42 ],
  132515. "D": [ 5525 ],
  132516. "Q": [ 275 ]
  132517. }
  132518. },
  132519. "memctrl_I.si_data_n_SB_DFF_Q_18": {
  132520. "hide_name": 0,
  132521. "type": "SB_DFF",
  132522. "parameters": {
  132523. },
  132524. "attributes": {
  132525. "module_not_derived": "00000000000000000000000000000001",
  132526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132527. },
  132528. "port_directions": {
  132529. "C": "input",
  132530. "D": "input",
  132531. "Q": "output"
  132532. },
  132533. "connections": {
  132534. "C": [ 42 ],
  132535. "D": [ 5526 ],
  132536. "Q": [ 276 ]
  132537. }
  132538. },
  132539. "memctrl_I.si_data_n_SB_DFF_Q_19": {
  132540. "hide_name": 0,
  132541. "type": "SB_DFF",
  132542. "parameters": {
  132543. },
  132544. "attributes": {
  132545. "module_not_derived": "00000000000000000000000000000001",
  132546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132547. },
  132548. "port_directions": {
  132549. "C": "input",
  132550. "D": "input",
  132551. "Q": "output"
  132552. },
  132553. "connections": {
  132554. "C": [ 42 ],
  132555. "D": [ 5527 ],
  132556. "Q": [ 277 ]
  132557. }
  132558. },
  132559. "memctrl_I.si_data_n_SB_DFF_Q_2": {
  132560. "hide_name": 0,
  132561. "type": "SB_DFF",
  132562. "parameters": {
  132563. },
  132564. "attributes": {
  132565. "module_not_derived": "00000000000000000000000000000001",
  132566. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132567. },
  132568. "port_directions": {
  132569. "C": "input",
  132570. "D": "input",
  132571. "Q": "output"
  132572. },
  132573. "connections": {
  132574. "C": [ 42 ],
  132575. "D": [ 5528 ],
  132576. "Q": [ 269 ]
  132577. }
  132578. },
  132579. "memctrl_I.si_data_n_SB_DFF_Q_20": {
  132580. "hide_name": 0,
  132581. "type": "SB_DFF",
  132582. "parameters": {
  132583. },
  132584. "attributes": {
  132585. "module_not_derived": "00000000000000000000000000000001",
  132586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132587. },
  132588. "port_directions": {
  132589. "C": "input",
  132590. "D": "input",
  132591. "Q": "output"
  132592. },
  132593. "connections": {
  132594. "C": [ 42 ],
  132595. "D": [ 5529 ],
  132596. "Q": [ 219 ]
  132597. }
  132598. },
  132599. "memctrl_I.si_data_n_SB_DFF_Q_21": {
  132600. "hide_name": 0,
  132601. "type": "SB_DFF",
  132602. "parameters": {
  132603. },
  132604. "attributes": {
  132605. "module_not_derived": "00000000000000000000000000000001",
  132606. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132607. },
  132608. "port_directions": {
  132609. "C": "input",
  132610. "D": "input",
  132611. "Q": "output"
  132612. },
  132613. "connections": {
  132614. "C": [ 42 ],
  132615. "D": [ 5530 ],
  132616. "Q": [ 220 ]
  132617. }
  132618. },
  132619. "memctrl_I.si_data_n_SB_DFF_Q_22": {
  132620. "hide_name": 0,
  132621. "type": "SB_DFF",
  132622. "parameters": {
  132623. },
  132624. "attributes": {
  132625. "module_not_derived": "00000000000000000000000000000001",
  132626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132627. },
  132628. "port_directions": {
  132629. "C": "input",
  132630. "D": "input",
  132631. "Q": "output"
  132632. },
  132633. "connections": {
  132634. "C": [ 42 ],
  132635. "D": [ 5531 ],
  132636. "Q": [ 221 ]
  132637. }
  132638. },
  132639. "memctrl_I.si_data_n_SB_DFF_Q_23": {
  132640. "hide_name": 0,
  132641. "type": "SB_DFF",
  132642. "parameters": {
  132643. },
  132644. "attributes": {
  132645. "module_not_derived": "00000000000000000000000000000001",
  132646. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132647. },
  132648. "port_directions": {
  132649. "C": "input",
  132650. "D": "input",
  132651. "Q": "output"
  132652. },
  132653. "connections": {
  132654. "C": [ 42 ],
  132655. "D": [ 5532 ],
  132656. "Q": [ 222 ]
  132657. }
  132658. },
  132659. "memctrl_I.si_data_n_SB_DFF_Q_24": {
  132660. "hide_name": 0,
  132661. "type": "SB_DFF",
  132662. "parameters": {
  132663. },
  132664. "attributes": {
  132665. "module_not_derived": "00000000000000000000000000000001",
  132666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132667. },
  132668. "port_directions": {
  132669. "C": "input",
  132670. "D": "input",
  132671. "Q": "output"
  132672. },
  132673. "connections": {
  132674. "C": [ 42 ],
  132675. "D": [ 5533 ],
  132676. "Q": [ 280 ]
  132677. }
  132678. },
  132679. "memctrl_I.si_data_n_SB_DFF_Q_25": {
  132680. "hide_name": 0,
  132681. "type": "SB_DFF",
  132682. "parameters": {
  132683. },
  132684. "attributes": {
  132685. "module_not_derived": "00000000000000000000000000000001",
  132686. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132687. },
  132688. "port_directions": {
  132689. "C": "input",
  132690. "D": "input",
  132691. "Q": "output"
  132692. },
  132693. "connections": {
  132694. "C": [ 42 ],
  132695. "D": [ 5534 ],
  132696. "Q": [ 271 ]
  132697. }
  132698. },
  132699. "memctrl_I.si_data_n_SB_DFF_Q_26": {
  132700. "hide_name": 0,
  132701. "type": "SB_DFF",
  132702. "parameters": {
  132703. },
  132704. "attributes": {
  132705. "module_not_derived": "00000000000000000000000000000001",
  132706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132707. },
  132708. "port_directions": {
  132709. "C": "input",
  132710. "D": "input",
  132711. "Q": "output"
  132712. },
  132713. "connections": {
  132714. "C": [ 42 ],
  132715. "D": [ 5535 ],
  132716. "Q": [ 272 ]
  132717. }
  132718. },
  132719. "memctrl_I.si_data_n_SB_DFF_Q_27": {
  132720. "hide_name": 0,
  132721. "type": "SB_DFF",
  132722. "parameters": {
  132723. },
  132724. "attributes": {
  132725. "module_not_derived": "00000000000000000000000000000001",
  132726. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132727. },
  132728. "port_directions": {
  132729. "C": "input",
  132730. "D": "input",
  132731. "Q": "output"
  132732. },
  132733. "connections": {
  132734. "C": [ 42 ],
  132735. "D": [ 5536 ],
  132736. "Q": [ 273 ]
  132737. }
  132738. },
  132739. "memctrl_I.si_data_n_SB_DFF_Q_28": {
  132740. "hide_name": 0,
  132741. "type": "SB_DFF",
  132742. "parameters": {
  132743. },
  132744. "attributes": {
  132745. "module_not_derived": "00000000000000000000000000000001",
  132746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132747. },
  132748. "port_directions": {
  132749. "C": "input",
  132750. "D": "input",
  132751. "Q": "output"
  132752. },
  132753. "connections": {
  132754. "C": [ 42 ],
  132755. "D": [ 5537 ],
  132756. "Q": [ 225 ]
  132757. }
  132758. },
  132759. "memctrl_I.si_data_n_SB_DFF_Q_29": {
  132760. "hide_name": 0,
  132761. "type": "SB_DFF",
  132762. "parameters": {
  132763. },
  132764. "attributes": {
  132765. "module_not_derived": "00000000000000000000000000000001",
  132766. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132767. },
  132768. "port_directions": {
  132769. "C": "input",
  132770. "D": "input",
  132771. "Q": "output"
  132772. },
  132773. "connections": {
  132774. "C": [ 42 ],
  132775. "D": [ 5538 ],
  132776. "Q": [ 216 ]
  132777. }
  132778. },
  132779. "memctrl_I.si_data_n_SB_DFF_Q_3": {
  132780. "hide_name": 0,
  132781. "type": "SB_DFF",
  132782. "parameters": {
  132783. },
  132784. "attributes": {
  132785. "module_not_derived": "00000000000000000000000000000001",
  132786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132787. },
  132788. "port_directions": {
  132789. "C": "input",
  132790. "D": "input",
  132791. "Q": "output"
  132792. },
  132793. "connections": {
  132794. "C": [ 42 ],
  132795. "D": [ 5539 ],
  132796. "Q": [ 270 ]
  132797. }
  132798. },
  132799. "memctrl_I.si_data_n_SB_DFF_Q_30": {
  132800. "hide_name": 0,
  132801. "type": "SB_DFF",
  132802. "parameters": {
  132803. },
  132804. "attributes": {
  132805. "module_not_derived": "00000000000000000000000000000001",
  132806. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132807. },
  132808. "port_directions": {
  132809. "C": "input",
  132810. "D": "input",
  132811. "Q": "output"
  132812. },
  132813. "connections": {
  132814. "C": [ 42 ],
  132815. "D": [ 5540 ],
  132816. "Q": [ 217 ]
  132817. }
  132818. },
  132819. "memctrl_I.si_data_n_SB_DFF_Q_31": {
  132820. "hide_name": 0,
  132821. "type": "SB_DFF",
  132822. "parameters": {
  132823. },
  132824. "attributes": {
  132825. "module_not_derived": "00000000000000000000000000000001",
  132826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132827. },
  132828. "port_directions": {
  132829. "C": "input",
  132830. "D": "input",
  132831. "Q": "output"
  132832. },
  132833. "connections": {
  132834. "C": [ 42 ],
  132835. "D": [ 5541 ],
  132836. "Q": [ 218 ]
  132837. }
  132838. },
  132839. "memctrl_I.si_data_n_SB_DFF_Q_4": {
  132840. "hide_name": 0,
  132841. "type": "SB_DFF",
  132842. "parameters": {
  132843. },
  132844. "attributes": {
  132845. "module_not_derived": "00000000000000000000000000000001",
  132846. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132847. },
  132848. "port_directions": {
  132849. "C": "input",
  132850. "D": "input",
  132851. "Q": "output"
  132852. },
  132853. "connections": {
  132854. "C": [ 42 ],
  132855. "D": [ 5542 ],
  132856. "Q": [ 212 ]
  132857. }
  132858. },
  132859. "memctrl_I.si_data_n_SB_DFF_Q_5": {
  132860. "hide_name": 0,
  132861. "type": "SB_DFF",
  132862. "parameters": {
  132863. },
  132864. "attributes": {
  132865. "module_not_derived": "00000000000000000000000000000001",
  132866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132867. },
  132868. "port_directions": {
  132869. "C": "input",
  132870. "D": "input",
  132871. "Q": "output"
  132872. },
  132873. "connections": {
  132874. "C": [ 42 ],
  132875. "D": [ 5543 ],
  132876. "Q": [ 213 ]
  132877. }
  132878. },
  132879. "memctrl_I.si_data_n_SB_DFF_Q_6": {
  132880. "hide_name": 0,
  132881. "type": "SB_DFF",
  132882. "parameters": {
  132883. },
  132884. "attributes": {
  132885. "module_not_derived": "00000000000000000000000000000001",
  132886. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132887. },
  132888. "port_directions": {
  132889. "C": "input",
  132890. "D": "input",
  132891. "Q": "output"
  132892. },
  132893. "connections": {
  132894. "C": [ 42 ],
  132895. "D": [ 5544 ],
  132896. "Q": [ 214 ]
  132897. }
  132898. },
  132899. "memctrl_I.si_data_n_SB_DFF_Q_7": {
  132900. "hide_name": 0,
  132901. "type": "SB_DFF",
  132902. "parameters": {
  132903. },
  132904. "attributes": {
  132905. "module_not_derived": "00000000000000000000000000000001",
  132906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132907. },
  132908. "port_directions": {
  132909. "C": "input",
  132910. "D": "input",
  132911. "Q": "output"
  132912. },
  132913. "connections": {
  132914. "C": [ 42 ],
  132915. "D": [ 5545 ],
  132916. "Q": [ 215 ]
  132917. }
  132918. },
  132919. "memctrl_I.si_data_n_SB_DFF_Q_8": {
  132920. "hide_name": 0,
  132921. "type": "SB_DFF",
  132922. "parameters": {
  132923. },
  132924. "attributes": {
  132925. "module_not_derived": "00000000000000000000000000000001",
  132926. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132927. },
  132928. "port_directions": {
  132929. "C": "input",
  132930. "D": "input",
  132931. "Q": "output"
  132932. },
  132933. "connections": {
  132934. "C": [ 42 ],
  132935. "D": [ 5546 ],
  132936. "Q": [ 278 ]
  132937. }
  132938. },
  132939. "memctrl_I.si_data_n_SB_DFF_Q_9": {
  132940. "hide_name": 0,
  132941. "type": "SB_DFF",
  132942. "parameters": {
  132943. },
  132944. "attributes": {
  132945. "module_not_derived": "00000000000000000000000000000001",
  132946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:773.2-782.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  132947. },
  132948. "port_directions": {
  132949. "C": "input",
  132950. "D": "input",
  132951. "Q": "output"
  132952. },
  132953. "connections": {
  132954. "C": [ 42 ],
  132955. "D": [ 5547 ],
  132956. "Q": [ 279 ]
  132957. }
  132958. },
  132959. "memctrl_I.si_dst_1_SB_DFFSR_Q": {
  132960. "hide_name": 0,
  132961. "type": "SB_DFFSR",
  132962. "parameters": {
  132963. },
  132964. "attributes": {
  132965. "module_not_derived": "00000000000000000000000000000001",
  132966. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:758.2-766.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  132967. },
  132968. "port_directions": {
  132969. "C": "input",
  132970. "D": "input",
  132971. "Q": "output",
  132972. "R": "input"
  132973. },
  132974. "connections": {
  132975. "C": [ 42 ],
  132976. "D": [ 5548 ],
  132977. "Q": [ 5397 ],
  132978. "R": [ 5549 ]
  132979. }
  132980. },
  132981. "memctrl_I.si_dst_1_SB_DFFSR_Q_1": {
  132982. "hide_name": 0,
  132983. "type": "SB_DFFSR",
  132984. "parameters": {
  132985. },
  132986. "attributes": {
  132987. "module_not_derived": "00000000000000000000000000000001",
  132988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:758.2-766.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  132989. },
  132990. "port_directions": {
  132991. "C": "input",
  132992. "D": "input",
  132993. "Q": "output",
  132994. "R": "input"
  132995. },
  132996. "connections": {
  132997. "C": [ 42 ],
  132998. "D": [ 5550 ],
  132999. "Q": [ 5399 ],
  133000. "R": [ 5549 ]
  133001. }
  133002. },
  133003. "memctrl_I.si_dst_1_SB_DFFSR_Q_1_D_SB_LUT4_O": {
  133004. "hide_name": 0,
  133005. "type": "SB_LUT4",
  133006. "parameters": {
  133007. "LUT_INIT": "1111000011111111"
  133008. },
  133009. "attributes": {
  133010. "module_not_derived": "00000000000000000000000000000001",
  133011. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  133012. },
  133013. "port_directions": {
  133014. "I0": "input",
  133015. "I1": "input",
  133016. "I2": "input",
  133017. "I3": "input",
  133018. "O": "output"
  133019. },
  133020. "connections": {
  133021. "I0": [ "0" ],
  133022. "I1": [ "0" ],
  133023. "I2": [ 5462 ],
  133024. "I3": [ 5548 ],
  133025. "O": [ 5550 ]
  133026. }
  133027. },
  133028. "memctrl_I.si_dst_1_SB_DFFSR_Q_R_SB_LUT4_O": {
  133029. "hide_name": 0,
  133030. "type": "SB_LUT4",
  133031. "parameters": {
  133032. "LUT_INIT": "1101111111111111"
  133033. },
  133034. "attributes": {
  133035. "module_not_derived": "00000000000000000000000000000001",
  133036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  133037. },
  133038. "port_directions": {
  133039. "I0": "input",
  133040. "I1": "input",
  133041. "I2": "input",
  133042. "I3": "input",
  133043. "O": "output"
  133044. },
  133045. "connections": {
  133046. "I0": [ 5461 ],
  133047. "I1": [ 5551 ],
  133048. "I2": [ 5552 ],
  133049. "I3": [ 5553 ],
  133050. "O": [ 5549 ]
  133051. }
  133052. },
  133053. "memctrl_I.so_cnt_SB_CARRY_CI": {
  133054. "hide_name": 0,
  133055. "type": "SB_CARRY",
  133056. "parameters": {
  133057. },
  133058. "attributes": {
  133059. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  133060. },
  133061. "port_directions": {
  133062. "CI": "input",
  133063. "CO": "output",
  133064. "I0": "input",
  133065. "I1": "input"
  133066. },
  133067. "connections": {
  133068. "CI": [ 5554 ],
  133069. "CO": [ 5555 ],
  133070. "I0": [ 5556 ],
  133071. "I1": [ "1" ]
  133072. }
  133073. },
  133074. "memctrl_I.so_cnt_SB_CARRY_I0": {
  133075. "hide_name": 0,
  133076. "type": "SB_CARRY",
  133077. "parameters": {
  133078. },
  133079. "attributes": {
  133080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  133081. },
  133082. "port_directions": {
  133083. "CI": "input",
  133084. "CO": "output",
  133085. "I0": "input",
  133086. "I1": "input"
  133087. },
  133088. "connections": {
  133089. "CI": [ 5555 ],
  133090. "CO": [ 5557 ],
  133091. "I0": [ 5558 ],
  133092. "I1": [ "1" ]
  133093. }
  133094. },
  133095. "memctrl_I.so_cnt_SB_DFFE_Q": {
  133096. "hide_name": 0,
  133097. "type": "SB_DFFE",
  133098. "parameters": {
  133099. },
  133100. "attributes": {
  133101. "module_not_derived": "00000000000000000000000000000001",
  133102. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:691.2-695.33|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  133103. },
  133104. "port_directions": {
  133105. "C": "input",
  133106. "D": "input",
  133107. "E": "input",
  133108. "Q": "output"
  133109. },
  133110. "connections": {
  133111. "C": [ 42 ],
  133112. "D": [ 5559 ],
  133113. "E": [ 5390 ],
  133114. "Q": [ 5560 ]
  133115. }
  133116. },
  133117. "memctrl_I.so_cnt_SB_DFF_Q": {
  133118. "hide_name": 0,
  133119. "type": "SB_DFF",
  133120. "parameters": {
  133121. },
  133122. "attributes": {
  133123. "module_not_derived": "00000000000000000000000000000001",
  133124. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:691.2-695.33|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133125. },
  133126. "port_directions": {
  133127. "C": "input",
  133128. "D": "input",
  133129. "Q": "output"
  133130. },
  133131. "connections": {
  133132. "C": [ 42 ],
  133133. "D": [ 5561 ],
  133134. "Q": [ 5558 ]
  133135. }
  133136. },
  133137. "memctrl_I.so_cnt_SB_DFF_Q_1": {
  133138. "hide_name": 0,
  133139. "type": "SB_DFF",
  133140. "parameters": {
  133141. },
  133142. "attributes": {
  133143. "module_not_derived": "00000000000000000000000000000001",
  133144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:691.2-695.33|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133145. },
  133146. "port_directions": {
  133147. "C": "input",
  133148. "D": "input",
  133149. "Q": "output"
  133150. },
  133151. "connections": {
  133152. "C": [ 42 ],
  133153. "D": [ 5562 ],
  133154. "Q": [ 5556 ]
  133155. }
  133156. },
  133157. "memctrl_I.so_cnt_SB_DFF_Q_2": {
  133158. "hide_name": 0,
  133159. "type": "SB_DFF",
  133160. "parameters": {
  133161. },
  133162. "attributes": {
  133163. "module_not_derived": "00000000000000000000000000000001",
  133164. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:691.2-695.33|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133165. },
  133166. "port_directions": {
  133167. "C": "input",
  133168. "D": "input",
  133169. "Q": "output"
  133170. },
  133171. "connections": {
  133172. "C": [ 42 ],
  133173. "D": [ 5563 ],
  133174. "Q": [ 5554 ]
  133175. }
  133176. },
  133177. "memctrl_I.so_cnt_SB_DFF_Q_D_SB_LUT4_O": {
  133178. "hide_name": 0,
  133179. "type": "SB_LUT4",
  133180. "parameters": {
  133181. "LUT_INIT": "1100000011111111"
  133182. },
  133183. "attributes": {
  133184. "module_not_derived": "00000000000000000000000000000001",
  133185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  133186. },
  133187. "port_directions": {
  133188. "I0": "input",
  133189. "I1": "input",
  133190. "I2": "input",
  133191. "I3": "input",
  133192. "O": "output"
  133193. },
  133194. "connections": {
  133195. "I0": [ "0" ],
  133196. "I1": [ 5564 ],
  133197. "I2": [ 5424 ],
  133198. "I3": [ 5565 ],
  133199. "O": [ 5562 ]
  133200. }
  133201. },
  133202. "memctrl_I.so_cnt_SB_DFF_Q_D_SB_LUT4_O_1": {
  133203. "hide_name": 0,
  133204. "type": "SB_LUT4",
  133205. "parameters": {
  133206. "LUT_INIT": "1100000011111111"
  133207. },
  133208. "attributes": {
  133209. "module_not_derived": "00000000000000000000000000000001",
  133210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  133211. },
  133212. "port_directions": {
  133213. "I0": "input",
  133214. "I1": "input",
  133215. "I2": "input",
  133216. "I3": "input",
  133217. "O": "output"
  133218. },
  133219. "connections": {
  133220. "I0": [ "0" ],
  133221. "I1": [ 5566 ],
  133222. "I2": [ 5424 ],
  133223. "I3": [ 5567 ],
  133224. "O": [ 5561 ]
  133225. }
  133226. },
  133227. "memctrl_I.so_cnt_SB_LUT4_I1": {
  133228. "hide_name": 0,
  133229. "type": "SB_LUT4",
  133230. "parameters": {
  133231. "LUT_INIT": "0110100110010110"
  133232. },
  133233. "attributes": {
  133234. "module_not_derived": "00000000000000000000000000000001",
  133235. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  133236. },
  133237. "port_directions": {
  133238. "I0": "input",
  133239. "I1": "input",
  133240. "I2": "input",
  133241. "I3": "input",
  133242. "O": "output"
  133243. },
  133244. "connections": {
  133245. "I0": [ "0" ],
  133246. "I1": [ 5556 ],
  133247. "I2": [ "1" ],
  133248. "I3": [ 5554 ],
  133249. "O": [ 5564 ]
  133250. }
  133251. },
  133252. "memctrl_I.so_cnt_SB_LUT4_I1_1": {
  133253. "hide_name": 0,
  133254. "type": "SB_LUT4",
  133255. "parameters": {
  133256. "LUT_INIT": "0110100110010110"
  133257. },
  133258. "attributes": {
  133259. "module_not_derived": "00000000000000000000000000000001",
  133260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  133261. },
  133262. "port_directions": {
  133263. "I0": "input",
  133264. "I1": "input",
  133265. "I2": "input",
  133266. "I3": "input",
  133267. "O": "output"
  133268. },
  133269. "connections": {
  133270. "I0": [ "0" ],
  133271. "I1": [ 5558 ],
  133272. "I2": [ "1" ],
  133273. "I3": [ 5555 ],
  133274. "O": [ 5566 ]
  133275. }
  133276. },
  133277. "memctrl_I.so_cnt_SB_LUT4_I1_2": {
  133278. "hide_name": 0,
  133279. "type": "SB_LUT4",
  133280. "parameters": {
  133281. "LUT_INIT": "1111111100110000"
  133282. },
  133283. "attributes": {
  133284. "module_not_derived": "00000000000000000000000000000001",
  133285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  133286. },
  133287. "port_directions": {
  133288. "I0": "input",
  133289. "I1": "input",
  133290. "I2": "input",
  133291. "I3": "input",
  133292. "O": "output"
  133293. },
  133294. "connections": {
  133295. "I0": [ "0" ],
  133296. "I1": [ 5554 ],
  133297. "I2": [ 5424 ],
  133298. "I3": [ 5568 ],
  133299. "O": [ 5563 ]
  133300. }
  133301. },
  133302. "memctrl_I.so_data_SB_DFF_Q": {
  133303. "hide_name": 0,
  133304. "type": "SB_DFF",
  133305. "parameters": {
  133306. },
  133307. "attributes": {
  133308. "module_not_derived": "00000000000000000000000000000001",
  133309. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133310. },
  133311. "port_directions": {
  133312. "C": "input",
  133313. "D": "input",
  133314. "Q": "output"
  133315. },
  133316. "connections": {
  133317. "C": [ 42 ],
  133318. "D": [ 5569 ],
  133319. "Q": [ 5570 ]
  133320. }
  133321. },
  133322. "memctrl_I.so_data_SB_DFF_Q_1": {
  133323. "hide_name": 0,
  133324. "type": "SB_DFF",
  133325. "parameters": {
  133326. },
  133327. "attributes": {
  133328. "module_not_derived": "00000000000000000000000000000001",
  133329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133330. },
  133331. "port_directions": {
  133332. "C": "input",
  133333. "D": "input",
  133334. "Q": "output"
  133335. },
  133336. "connections": {
  133337. "C": [ 42 ],
  133338. "D": [ 5571 ],
  133339. "Q": [ 5572 ]
  133340. }
  133341. },
  133342. "memctrl_I.so_data_SB_DFF_Q_10": {
  133343. "hide_name": 0,
  133344. "type": "SB_DFF",
  133345. "parameters": {
  133346. },
  133347. "attributes": {
  133348. "module_not_derived": "00000000000000000000000000000001",
  133349. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133350. },
  133351. "port_directions": {
  133352. "C": "input",
  133353. "D": "input",
  133354. "Q": "output"
  133355. },
  133356. "connections": {
  133357. "C": [ 42 ],
  133358. "D": [ 5573 ],
  133359. "Q": [ 5574 ]
  133360. }
  133361. },
  133362. "memctrl_I.so_data_SB_DFF_Q_11": {
  133363. "hide_name": 0,
  133364. "type": "SB_DFF",
  133365. "parameters": {
  133366. },
  133367. "attributes": {
  133368. "module_not_derived": "00000000000000000000000000000001",
  133369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133370. },
  133371. "port_directions": {
  133372. "C": "input",
  133373. "D": "input",
  133374. "Q": "output"
  133375. },
  133376. "connections": {
  133377. "C": [ 42 ],
  133378. "D": [ 5575 ],
  133379. "Q": [ 5576 ]
  133380. }
  133381. },
  133382. "memctrl_I.so_data_SB_DFF_Q_12": {
  133383. "hide_name": 0,
  133384. "type": "SB_DFF",
  133385. "parameters": {
  133386. },
  133387. "attributes": {
  133388. "module_not_derived": "00000000000000000000000000000001",
  133389. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133390. },
  133391. "port_directions": {
  133392. "C": "input",
  133393. "D": "input",
  133394. "Q": "output"
  133395. },
  133396. "connections": {
  133397. "C": [ 42 ],
  133398. "D": [ 5577 ],
  133399. "Q": [ 5578 ]
  133400. }
  133401. },
  133402. "memctrl_I.so_data_SB_DFF_Q_13": {
  133403. "hide_name": 0,
  133404. "type": "SB_DFF",
  133405. "parameters": {
  133406. },
  133407. "attributes": {
  133408. "module_not_derived": "00000000000000000000000000000001",
  133409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133410. },
  133411. "port_directions": {
  133412. "C": "input",
  133413. "D": "input",
  133414. "Q": "output"
  133415. },
  133416. "connections": {
  133417. "C": [ 42 ],
  133418. "D": [ 5579 ],
  133419. "Q": [ 5580 ]
  133420. }
  133421. },
  133422. "memctrl_I.so_data_SB_DFF_Q_14": {
  133423. "hide_name": 0,
  133424. "type": "SB_DFF",
  133425. "parameters": {
  133426. },
  133427. "attributes": {
  133428. "module_not_derived": "00000000000000000000000000000001",
  133429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133430. },
  133431. "port_directions": {
  133432. "C": "input",
  133433. "D": "input",
  133434. "Q": "output"
  133435. },
  133436. "connections": {
  133437. "C": [ 42 ],
  133438. "D": [ 5581 ],
  133439. "Q": [ 5582 ]
  133440. }
  133441. },
  133442. "memctrl_I.so_data_SB_DFF_Q_15": {
  133443. "hide_name": 0,
  133444. "type": "SB_DFF",
  133445. "parameters": {
  133446. },
  133447. "attributes": {
  133448. "module_not_derived": "00000000000000000000000000000001",
  133449. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133450. },
  133451. "port_directions": {
  133452. "C": "input",
  133453. "D": "input",
  133454. "Q": "output"
  133455. },
  133456. "connections": {
  133457. "C": [ 42 ],
  133458. "D": [ 5583 ],
  133459. "Q": [ 5584 ]
  133460. }
  133461. },
  133462. "memctrl_I.so_data_SB_DFF_Q_16": {
  133463. "hide_name": 0,
  133464. "type": "SB_DFF",
  133465. "parameters": {
  133466. },
  133467. "attributes": {
  133468. "module_not_derived": "00000000000000000000000000000001",
  133469. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133470. },
  133471. "port_directions": {
  133472. "C": "input",
  133473. "D": "input",
  133474. "Q": "output"
  133475. },
  133476. "connections": {
  133477. "C": [ 42 ],
  133478. "D": [ 5585 ],
  133479. "Q": [ 5586 ]
  133480. }
  133481. },
  133482. "memctrl_I.so_data_SB_DFF_Q_17": {
  133483. "hide_name": 0,
  133484. "type": "SB_DFF",
  133485. "parameters": {
  133486. },
  133487. "attributes": {
  133488. "module_not_derived": "00000000000000000000000000000001",
  133489. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133490. },
  133491. "port_directions": {
  133492. "C": "input",
  133493. "D": "input",
  133494. "Q": "output"
  133495. },
  133496. "connections": {
  133497. "C": [ 42 ],
  133498. "D": [ 5587 ],
  133499. "Q": [ 5588 ]
  133500. }
  133501. },
  133502. "memctrl_I.so_data_SB_DFF_Q_18": {
  133503. "hide_name": 0,
  133504. "type": "SB_DFF",
  133505. "parameters": {
  133506. },
  133507. "attributes": {
  133508. "module_not_derived": "00000000000000000000000000000001",
  133509. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133510. },
  133511. "port_directions": {
  133512. "C": "input",
  133513. "D": "input",
  133514. "Q": "output"
  133515. },
  133516. "connections": {
  133517. "C": [ 42 ],
  133518. "D": [ 5589 ],
  133519. "Q": [ 5590 ]
  133520. }
  133521. },
  133522. "memctrl_I.so_data_SB_DFF_Q_19": {
  133523. "hide_name": 0,
  133524. "type": "SB_DFF",
  133525. "parameters": {
  133526. },
  133527. "attributes": {
  133528. "module_not_derived": "00000000000000000000000000000001",
  133529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133530. },
  133531. "port_directions": {
  133532. "C": "input",
  133533. "D": "input",
  133534. "Q": "output"
  133535. },
  133536. "connections": {
  133537. "C": [ 42 ],
  133538. "D": [ 5591 ],
  133539. "Q": [ 5592 ]
  133540. }
  133541. },
  133542. "memctrl_I.so_data_SB_DFF_Q_2": {
  133543. "hide_name": 0,
  133544. "type": "SB_DFF",
  133545. "parameters": {
  133546. },
  133547. "attributes": {
  133548. "module_not_derived": "00000000000000000000000000000001",
  133549. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133550. },
  133551. "port_directions": {
  133552. "C": "input",
  133553. "D": "input",
  133554. "Q": "output"
  133555. },
  133556. "connections": {
  133557. "C": [ 42 ],
  133558. "D": [ 5593 ],
  133559. "Q": [ 5594 ]
  133560. }
  133561. },
  133562. "memctrl_I.so_data_SB_DFF_Q_3": {
  133563. "hide_name": 0,
  133564. "type": "SB_DFF",
  133565. "parameters": {
  133566. },
  133567. "attributes": {
  133568. "module_not_derived": "00000000000000000000000000000001",
  133569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133570. },
  133571. "port_directions": {
  133572. "C": "input",
  133573. "D": "input",
  133574. "Q": "output"
  133575. },
  133576. "connections": {
  133577. "C": [ 42 ],
  133578. "D": [ 5595 ],
  133579. "Q": [ 5596 ]
  133580. }
  133581. },
  133582. "memctrl_I.so_data_SB_DFF_Q_4": {
  133583. "hide_name": 0,
  133584. "type": "SB_DFF",
  133585. "parameters": {
  133586. },
  133587. "attributes": {
  133588. "module_not_derived": "00000000000000000000000000000001",
  133589. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133590. },
  133591. "port_directions": {
  133592. "C": "input",
  133593. "D": "input",
  133594. "Q": "output"
  133595. },
  133596. "connections": {
  133597. "C": [ 42 ],
  133598. "D": [ 5597 ],
  133599. "Q": [ 5598 ]
  133600. }
  133601. },
  133602. "memctrl_I.so_data_SB_DFF_Q_5": {
  133603. "hide_name": 0,
  133604. "type": "SB_DFF",
  133605. "parameters": {
  133606. },
  133607. "attributes": {
  133608. "module_not_derived": "00000000000000000000000000000001",
  133609. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133610. },
  133611. "port_directions": {
  133612. "C": "input",
  133613. "D": "input",
  133614. "Q": "output"
  133615. },
  133616. "connections": {
  133617. "C": [ 42 ],
  133618. "D": [ 5599 ],
  133619. "Q": [ 5600 ]
  133620. }
  133621. },
  133622. "memctrl_I.so_data_SB_DFF_Q_6": {
  133623. "hide_name": 0,
  133624. "type": "SB_DFF",
  133625. "parameters": {
  133626. },
  133627. "attributes": {
  133628. "module_not_derived": "00000000000000000000000000000001",
  133629. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133630. },
  133631. "port_directions": {
  133632. "C": "input",
  133633. "D": "input",
  133634. "Q": "output"
  133635. },
  133636. "connections": {
  133637. "C": [ 42 ],
  133638. "D": [ 5601 ],
  133639. "Q": [ 5602 ]
  133640. }
  133641. },
  133642. "memctrl_I.so_data_SB_DFF_Q_7": {
  133643. "hide_name": 0,
  133644. "type": "SB_DFF",
  133645. "parameters": {
  133646. },
  133647. "attributes": {
  133648. "module_not_derived": "00000000000000000000000000000001",
  133649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133650. },
  133651. "port_directions": {
  133652. "C": "input",
  133653. "D": "input",
  133654. "Q": "output"
  133655. },
  133656. "connections": {
  133657. "C": [ 42 ],
  133658. "D": [ 5603 ],
  133659. "Q": [ 5604 ]
  133660. }
  133661. },
  133662. "memctrl_I.so_data_SB_DFF_Q_8": {
  133663. "hide_name": 0,
  133664. "type": "SB_DFF",
  133665. "parameters": {
  133666. },
  133667. "attributes": {
  133668. "module_not_derived": "00000000000000000000000000000001",
  133669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133670. },
  133671. "port_directions": {
  133672. "C": "input",
  133673. "D": "input",
  133674. "Q": "output"
  133675. },
  133676. "connections": {
  133677. "C": [ 42 ],
  133678. "D": [ 5605 ],
  133679. "Q": [ 5606 ]
  133680. }
  133681. },
  133682. "memctrl_I.so_data_SB_DFF_Q_9": {
  133683. "hide_name": 0,
  133684. "type": "SB_DFF",
  133685. "parameters": {
  133686. },
  133687. "attributes": {
  133688. "module_not_derived": "00000000000000000000000000000001",
  133689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133690. },
  133691. "port_directions": {
  133692. "C": "input",
  133693. "D": "input",
  133694. "Q": "output"
  133695. },
  133696. "connections": {
  133697. "C": [ 42 ],
  133698. "D": [ 5607 ],
  133699. "Q": [ 5608 ]
  133700. }
  133701. },
  133702. "memctrl_I.so_dst_SB_DFFESR_Q": {
  133703. "hide_name": 0,
  133704. "type": "SB_DFFESR",
  133705. "parameters": {
  133706. },
  133707. "attributes": {
  133708. "module_not_derived": "00000000000000000000000000000001",
  133709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:684.2-688.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  133710. },
  133711. "port_directions": {
  133712. "C": "input",
  133713. "D": "input",
  133714. "E": "input",
  133715. "Q": "output",
  133716. "R": "input"
  133717. },
  133718. "connections": {
  133719. "C": [ 42 ],
  133720. "D": [ 5395 ],
  133721. "E": [ 5390 ],
  133722. "Q": [ 5548 ],
  133723. "R": [ 5609 ]
  133724. }
  133725. },
  133726. "memctrl_I.so_dst_SB_DFFE_Q": {
  133727. "hide_name": 0,
  133728. "type": "SB_DFFE",
  133729. "parameters": {
  133730. },
  133731. "attributes": {
  133732. "module_not_derived": "00000000000000000000000000000001",
  133733. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:684.2-688.6|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  133734. },
  133735. "port_directions": {
  133736. "C": "input",
  133737. "D": "input",
  133738. "E": "input",
  133739. "Q": "output"
  133740. },
  133741. "connections": {
  133742. "C": [ 42 ],
  133743. "D": [ 5610 ],
  133744. "E": [ 5390 ],
  133745. "Q": [ 5552 ]
  133746. }
  133747. },
  133748. "memctrl_I.so_last_SB_DFF_Q": {
  133749. "hide_name": 0,
  133750. "type": "SB_DFF",
  133751. "parameters": {
  133752. },
  133753. "attributes": {
  133754. "module_not_derived": "00000000000000000000000000000001",
  133755. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:691.2-695.33|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  133756. },
  133757. "port_directions": {
  133758. "C": "input",
  133759. "D": "input",
  133760. "Q": "output"
  133761. },
  133762. "connections": {
  133763. "C": [ 42 ],
  133764. "D": [ 5611 ],
  133765. "Q": [ 5553 ]
  133766. }
  133767. },
  133768. "memctrl_I.so_last_SB_LUT4_I1": {
  133769. "hide_name": 0,
  133770. "type": "SB_LUT4",
  133771. "parameters": {
  133772. "LUT_INIT": "1111100011110010"
  133773. },
  133774. "attributes": {
  133775. "module_not_derived": "00000000000000000000000000000001",
  133776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  133777. },
  133778. "port_directions": {
  133779. "I0": "input",
  133780. "I1": "input",
  133781. "I2": "input",
  133782. "I3": "input",
  133783. "O": "output"
  133784. },
  133785. "connections": {
  133786. "I0": [ 5424 ],
  133787. "I1": [ 5553 ],
  133788. "I2": [ 5568 ],
  133789. "I3": [ 5557 ],
  133790. "O": [ 5611 ]
  133791. }
  133792. },
  133793. "memctrl_I.so_last_SB_LUT4_I2": {
  133794. "hide_name": 0,
  133795. "type": "SB_LUT4",
  133796. "parameters": {
  133797. "LUT_INIT": "0000111100000000"
  133798. },
  133799. "attributes": {
  133800. "module_not_derived": "00000000000000000000000000000001",
  133801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  133802. },
  133803. "port_directions": {
  133804. "I0": "input",
  133805. "I1": "input",
  133806. "I2": "input",
  133807. "I3": "input",
  133808. "O": "output"
  133809. },
  133810. "connections": {
  133811. "I0": [ "0" ],
  133812. "I1": [ "0" ],
  133813. "I2": [ 5553 ],
  133814. "I3": [ 5612 ],
  133815. "O": [ 5613 ]
  133816. }
  133817. },
  133818. "memctrl_I.so_last_SB_LUT4_I3": {
  133819. "hide_name": 0,
  133820. "type": "SB_LUT4",
  133821. "parameters": {
  133822. "LUT_INIT": "0000000011110000"
  133823. },
  133824. "attributes": {
  133825. "module_not_derived": "00000000000000000000000000000001",
  133826. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  133827. },
  133828. "port_directions": {
  133829. "I0": "input",
  133830. "I1": "input",
  133831. "I2": "input",
  133832. "I3": "input",
  133833. "O": "output"
  133834. },
  133835. "connections": {
  133836. "I0": [ "0" ],
  133837. "I1": [ "0" ],
  133838. "I2": [ 5461 ],
  133839. "I3": [ 5553 ],
  133840. "O": [ 5424 ]
  133841. }
  133842. },
  133843. "memctrl_I.so_ld_cnt_SB_LUT4_O": {
  133844. "hide_name": 0,
  133845. "type": "SB_LUT4",
  133846. "parameters": {
  133847. "LUT_INIT": "0101111101001111"
  133848. },
  133849. "attributes": {
  133850. "module_not_derived": "00000000000000000000000000000001",
  133851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  133852. },
  133853. "port_directions": {
  133854. "I0": "input",
  133855. "I1": "input",
  133856. "I2": "input",
  133857. "I3": "input",
  133858. "O": "output"
  133859. },
  133860. "connections": {
  133861. "I0": [ 5393 ],
  133862. "I1": [ 5614 ],
  133863. "I2": [ 5615 ],
  133864. "I3": [ 5616 ],
  133865. "O": [ 5559 ]
  133866. }
  133867. },
  133868. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3": {
  133869. "hide_name": 0,
  133870. "type": "SB_LUT4",
  133871. "parameters": {
  133872. "LUT_INIT": "0000000011111100"
  133873. },
  133874. "attributes": {
  133875. "module_not_derived": "00000000000000000000000000000001",
  133876. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  133877. },
  133878. "port_directions": {
  133879. "I0": "input",
  133880. "I1": "input",
  133881. "I2": "input",
  133882. "I3": "input",
  133883. "O": "output"
  133884. },
  133885. "connections": {
  133886. "I0": [ "0" ],
  133887. "I1": [ 133 ],
  133888. "I2": [ 5390 ],
  133889. "I3": [ 5615 ],
  133890. "O": [ 649 ]
  133891. }
  133892. },
  133893. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_1": {
  133894. "hide_name": 0,
  133895. "type": "SB_LUT4",
  133896. "parameters": {
  133897. "LUT_INIT": "0000111100000000"
  133898. },
  133899. "attributes": {
  133900. "module_not_derived": "00000000000000000000000000000001",
  133901. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  133902. },
  133903. "port_directions": {
  133904. "I0": "input",
  133905. "I1": "input",
  133906. "I2": "input",
  133907. "I3": "input",
  133908. "O": "output"
  133909. },
  133910. "connections": {
  133911. "I0": [ "0" ],
  133912. "I1": [ "0" ],
  133913. "I2": [ 5393 ],
  133914. "I3": [ 5615 ],
  133915. "O": [ 5609 ]
  133916. }
  133917. },
  133918. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_1_O_SB_DFFER_Q": {
  133919. "hide_name": 0,
  133920. "type": "SB_DFFER",
  133921. "parameters": {
  133922. },
  133923. "attributes": {
  133924. "module_not_derived": "00000000000000000000000000000001",
  133925. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  133926. },
  133927. "port_directions": {
  133928. "C": "input",
  133929. "D": "input",
  133930. "E": "input",
  133931. "Q": "output",
  133932. "R": "input"
  133933. },
  133934. "connections": {
  133935. "C": [ 42 ],
  133936. "D": [ 699 ],
  133937. "E": [ 5392 ],
  133938. "Q": [ 5617 ],
  133939. "R": [ 127 ]
  133940. }
  133941. },
  133942. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_1_O_SB_LUT4_I3": {
  133943. "hide_name": 0,
  133944. "type": "SB_LUT4",
  133945. "parameters": {
  133946. "LUT_INIT": "1111000000000000"
  133947. },
  133948. "attributes": {
  133949. "module_not_derived": "00000000000000000000000000000001",
  133950. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  133951. },
  133952. "port_directions": {
  133953. "I0": "input",
  133954. "I1": "input",
  133955. "I2": "input",
  133956. "I3": "input",
  133957. "O": "output"
  133958. },
  133959. "connections": {
  133960. "I0": [ "0" ],
  133961. "I1": [ "0" ],
  133962. "I2": [ 5390 ],
  133963. "I3": [ 5609 ],
  133964. "O": [ 5618 ]
  133965. }
  133966. },
  133967. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_DFFER_Q": {
  133968. "hide_name": 0,
  133969. "type": "SB_DFFER",
  133970. "parameters": {
  133971. },
  133972. "attributes": {
  133973. "module_not_derived": "00000000000000000000000000000001",
  133974. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  133975. },
  133976. "port_directions": {
  133977. "C": "input",
  133978. "D": "input",
  133979. "E": "input",
  133980. "Q": "output",
  133981. "R": "input"
  133982. },
  133983. "connections": {
  133984. "C": [ 42 ],
  133985. "D": [ 704 ],
  133986. "E": [ 5392 ],
  133987. "Q": [ 5619 ],
  133988. "R": [ 127 ]
  133989. }
  133990. },
  133991. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_O": {
  133992. "hide_name": 0,
  133993. "type": "SB_LUT4",
  133994. "parameters": {
  133995. "LUT_INIT": "0000000000000011"
  133996. },
  133997. "attributes": {
  133998. "module_not_derived": "00000000000000000000000000000001",
  133999. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134000. },
  134001. "port_directions": {
  134002. "I0": "input",
  134003. "I1": "input",
  134004. "I2": "input",
  134005. "I3": "input",
  134006. "O": "output"
  134007. },
  134008. "connections": {
  134009. "I0": [ "0" ],
  134010. "I1": [ 133 ],
  134011. "I2": [ 5394 ],
  134012. "I3": [ 5395 ],
  134013. "O": [ 5615 ]
  134014. }
  134015. },
  134016. "memctrl_I.so_ld_dst_SB_LUT4_O": {
  134017. "hide_name": 0,
  134018. "type": "SB_LUT4",
  134019. "parameters": {
  134020. "LUT_INIT": "1100111111001100"
  134021. },
  134022. "attributes": {
  134023. "module_not_derived": "00000000000000000000000000000001",
  134024. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134025. },
  134026. "port_directions": {
  134027. "I0": "input",
  134028. "I1": "input",
  134029. "I2": "input",
  134030. "I3": "input",
  134031. "O": "output"
  134032. },
  134033. "connections": {
  134034. "I0": [ "0" ],
  134035. "I1": [ 5395 ],
  134036. "I2": [ 5617 ],
  134037. "I3": [ 5609 ],
  134038. "O": [ 5610 ]
  134039. }
  134040. },
  134041. "memctrl_I.so_ld_now_SB_LUT4_O": {
  134042. "hide_name": 0,
  134043. "type": "SB_LUT4",
  134044. "parameters": {
  134045. "LUT_INIT": "1111111100001111"
  134046. },
  134047. "attributes": {
  134048. "module_not_derived": "00000000000000000000000000000001",
  134049. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134050. },
  134051. "port_directions": {
  134052. "I0": "input",
  134053. "I1": "input",
  134054. "I2": "input",
  134055. "I3": "input",
  134056. "O": "output"
  134057. },
  134058. "connections": {
  134059. "I0": [ "0" ],
  134060. "I1": [ "0" ],
  134061. "I2": [ 5461 ],
  134062. "I3": [ 5553 ],
  134063. "O": [ 5390 ]
  134064. }
  134065. },
  134066. "memctrl_I.so_mode_SB_DFFESS_Q": {
  134067. "hide_name": 0,
  134068. "type": "SB_DFFESS",
  134069. "parameters": {
  134070. },
  134071. "attributes": {
  134072. "module_not_derived": "00000000000000000000000000000001",
  134073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:684.2-688.6|/usr/bin/../share/yosys/ice40/ff_map.v:25.66-25.119"
  134074. },
  134075. "port_directions": {
  134076. "C": "input",
  134077. "D": "input",
  134078. "E": "input",
  134079. "Q": "output",
  134080. "S": "input"
  134081. },
  134082. "connections": {
  134083. "C": [ 42 ],
  134084. "D": [ 5620 ],
  134085. "E": [ 5390 ],
  134086. "Q": [ 5551 ],
  134087. "S": [ 5405 ]
  134088. }
  134089. },
  134090. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O": {
  134091. "hide_name": 0,
  134092. "type": "SB_LUT4",
  134093. "parameters": {
  134094. "LUT_INIT": "1111110011110000"
  134095. },
  134096. "attributes": {
  134097. "module_not_derived": "00000000000000000000000000000001",
  134098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134099. },
  134100. "port_directions": {
  134101. "I0": "input",
  134102. "I1": "input",
  134103. "I2": "input",
  134104. "I3": "input",
  134105. "O": "output"
  134106. },
  134107. "connections": {
  134108. "I0": [ "0" ],
  134109. "I1": [ 5389 ],
  134110. "I2": [ 5394 ],
  134111. "I3": [ 5617 ],
  134112. "O": [ 5620 ]
  134113. }
  134114. },
  134115. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1": {
  134116. "hide_name": 0,
  134117. "type": "SB_LUT4",
  134118. "parameters": {
  134119. "LUT_INIT": "1111111011111100"
  134120. },
  134121. "attributes": {
  134122. "module_not_derived": "00000000000000000000000000000001",
  134123. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  134124. },
  134125. "port_directions": {
  134126. "I0": "input",
  134127. "I1": "input",
  134128. "I2": "input",
  134129. "I3": "input",
  134130. "O": "output"
  134131. },
  134132. "connections": {
  134133. "I0": [ 5389 ],
  134134. "I1": [ 5393 ],
  134135. "I2": [ 5395 ],
  134136. "I3": [ 5621 ],
  134137. "O": [ 5403 ]
  134138. }
  134139. },
  134140. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_DFFER_Q": {
  134141. "hide_name": 0,
  134142. "type": "SB_DFFER",
  134143. "parameters": {
  134144. },
  134145. "attributes": {
  134146. "module_not_derived": "00000000000000000000000000000001",
  134147. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  134148. },
  134149. "port_directions": {
  134150. "C": "input",
  134151. "D": "input",
  134152. "E": "input",
  134153. "Q": "output",
  134154. "R": "input"
  134155. },
  134156. "connections": {
  134157. "C": [ 42 ],
  134158. "D": [ 701 ],
  134159. "E": [ 5392 ],
  134160. "Q": [ 5621 ],
  134161. "R": [ 127 ]
  134162. }
  134163. },
  134164. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2": {
  134165. "hide_name": 0,
  134166. "type": "SB_LUT4",
  134167. "parameters": {
  134168. "LUT_INIT": "0000000000001111"
  134169. },
  134170. "attributes": {
  134171. "module_not_derived": "00000000000000000000000000000001",
  134172. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134173. },
  134174. "port_directions": {
  134175. "I0": "input",
  134176. "I1": "input",
  134177. "I2": "input",
  134178. "I3": "input",
  134179. "O": "output"
  134180. },
  134181. "connections": {
  134182. "I0": [ "0" ],
  134183. "I1": [ "0" ],
  134184. "I2": [ 5621 ],
  134185. "I3": [ 5617 ],
  134186. "O": [ 5616 ]
  134187. }
  134188. },
  134189. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_DFFER_Q": {
  134190. "hide_name": 0,
  134191. "type": "SB_DFFER",
  134192. "parameters": {
  134193. },
  134194. "attributes": {
  134195. "module_not_derived": "00000000000000000000000000000001",
  134196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  134197. },
  134198. "port_directions": {
  134199. "C": "input",
  134200. "D": "input",
  134201. "E": "input",
  134202. "Q": "output",
  134203. "R": "input"
  134204. },
  134205. "connections": {
  134206. "C": [ 42 ],
  134207. "D": [ 706 ],
  134208. "E": [ 5392 ],
  134209. "Q": [ 5614 ],
  134210. "R": [ 127 ]
  134211. }
  134212. },
  134213. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_I0": {
  134214. "hide_name": 0,
  134215. "type": "SB_LUT4",
  134216. "parameters": {
  134217. "LUT_INIT": "0101110011111111"
  134218. },
  134219. "attributes": {
  134220. "module_not_derived": "00000000000000000000000000000001",
  134221. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  134222. },
  134223. "port_directions": {
  134224. "I0": "input",
  134225. "I1": "input",
  134226. "I2": "input",
  134227. "I3": "input",
  134228. "O": "output"
  134229. },
  134230. "connections": {
  134231. "I0": [ 5614 ],
  134232. "I1": [ 5619 ],
  134233. "I2": [ 5616 ],
  134234. "I3": [ 5618 ],
  134235. "O": [ 5565 ]
  134236. }
  134237. },
  134238. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_I2": {
  134239. "hide_name": 0,
  134240. "type": "SB_LUT4",
  134241. "parameters": {
  134242. "LUT_INIT": "0011110011111111"
  134243. },
  134244. "attributes": {
  134245. "module_not_derived": "00000000000000000000000000000001",
  134246. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134247. },
  134248. "port_directions": {
  134249. "I0": "input",
  134250. "I1": "input",
  134251. "I2": "input",
  134252. "I3": "input",
  134253. "O": "output"
  134254. },
  134255. "connections": {
  134256. "I0": [ "0" ],
  134257. "I1": [ 5619 ],
  134258. "I2": [ 5616 ],
  134259. "I3": [ 5618 ],
  134260. "O": [ 5567 ]
  134261. }
  134262. },
  134263. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_I2_1": {
  134264. "hide_name": 0,
  134265. "type": "SB_LUT4",
  134266. "parameters": {
  134267. "LUT_INIT": "0000001100000000"
  134268. },
  134269. "attributes": {
  134270. "module_not_derived": "00000000000000000000000000000001",
  134271. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134272. },
  134273. "port_directions": {
  134274. "I0": "input",
  134275. "I1": "input",
  134276. "I2": "input",
  134277. "I3": "input",
  134278. "O": "output"
  134279. },
  134280. "connections": {
  134281. "I0": [ "0" ],
  134282. "I1": [ 5619 ],
  134283. "I2": [ 5616 ],
  134284. "I3": [ 5618 ],
  134285. "O": [ 5568 ]
  134286. }
  134287. },
  134288. "memctrl_I.so_mode_SB_DFFESS_Q_S_SB_LUT4_O": {
  134289. "hide_name": 0,
  134290. "type": "SB_LUT4",
  134291. "parameters": {
  134292. "LUT_INIT": "0000111100000000"
  134293. },
  134294. "attributes": {
  134295. "module_not_derived": "00000000000000000000000000000001",
  134296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134297. },
  134298. "port_directions": {
  134299. "I0": "input",
  134300. "I1": "input",
  134301. "I2": "input",
  134302. "I3": "input",
  134303. "O": "output"
  134304. },
  134305. "connections": {
  134306. "I0": [ "0" ],
  134307. "I1": [ "0" ],
  134308. "I2": [ 5389 ],
  134309. "I3": [ 5396 ],
  134310. "O": [ 5405 ]
  134311. }
  134312. },
  134313. "memctrl_I.so_mode_SB_LUT4_I2": {
  134314. "hide_name": 0,
  134315. "type": "SB_LUT4",
  134316. "parameters": {
  134317. "LUT_INIT": "0000000000001111"
  134318. },
  134319. "attributes": {
  134320. "module_not_derived": "00000000000000000000000000000001",
  134321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134322. },
  134323. "port_directions": {
  134324. "I0": "input",
  134325. "I1": "input",
  134326. "I2": "input",
  134327. "I3": "input",
  134328. "O": "output"
  134329. },
  134330. "connections": {
  134331. "I0": [ "0" ],
  134332. "I1": [ "0" ],
  134333. "I2": [ 5551 ],
  134334. "I3": [ 5390 ],
  134335. "O": [ 5622 ]
  134336. }
  134337. },
  134338. "memctrl_I.so_mode_SB_LUT4_I2_O_SB_LUT4_O": {
  134339. "hide_name": 0,
  134340. "type": "SB_LUT4",
  134341. "parameters": {
  134342. "LUT_INIT": "0001001101011111"
  134343. },
  134344. "attributes": {
  134345. "module_not_derived": "00000000000000000000000000000001",
  134346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  134347. },
  134348. "port_directions": {
  134349. "I0": "input",
  134350. "I1": "input",
  134351. "I2": "input",
  134352. "I3": "input",
  134353. "O": "output"
  134354. },
  134355. "connections": {
  134356. "I0": [ 155 ],
  134357. "I1": [ 5420 ],
  134358. "I2": [ 5419 ],
  134359. "I3": [ 5418 ],
  134360. "O": [ 5623 ]
  134361. }
  134362. },
  134363. "memctrl_I.so_mode_SB_LUT4_I2_O_SB_LUT4_O_1": {
  134364. "hide_name": 0,
  134365. "type": "SB_LUT4",
  134366. "parameters": {
  134367. "LUT_INIT": "1111000000000000"
  134368. },
  134369. "attributes": {
  134370. "module_not_derived": "00000000000000000000000000000001",
  134371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134372. },
  134373. "port_directions": {
  134374. "I0": "input",
  134375. "I1": "input",
  134376. "I2": "input",
  134377. "I3": "input",
  134378. "O": "output"
  134379. },
  134380. "connections": {
  134381. "I0": [ "0" ],
  134382. "I1": [ "0" ],
  134383. "I2": [ 188 ],
  134384. "I3": [ 122 ],
  134385. "O": [ 5624 ]
  134386. }
  134387. },
  134388. "memctrl_I.so_valid_SB_DFFSR_Q": {
  134389. "hide_name": 0,
  134390. "type": "SB_DFFSR",
  134391. "parameters": {
  134392. },
  134393. "attributes": {
  134394. "module_not_derived": "00000000000000000000000000000001",
  134395. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:677.2-681.66|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134396. },
  134397. "port_directions": {
  134398. "C": "input",
  134399. "D": "input",
  134400. "Q": "output",
  134401. "R": "input"
  134402. },
  134403. "connections": {
  134404. "C": [ 42 ],
  134405. "D": [ 5625 ],
  134406. "Q": [ 5461 ],
  134407. "R": [ 127 ]
  134408. }
  134409. },
  134410. "memctrl_I.so_valid_SB_DFFSR_Q_D_SB_LUT4_O": {
  134411. "hide_name": 0,
  134412. "type": "SB_LUT4",
  134413. "parameters": {
  134414. "LUT_INIT": "0000110011111111"
  134415. },
  134416. "attributes": {
  134417. "module_not_derived": "00000000000000000000000000000001",
  134418. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134419. },
  134420. "port_directions": {
  134421. "I0": "input",
  134422. "I1": "input",
  134423. "I2": "input",
  134424. "I3": "input",
  134425. "O": "output"
  134426. },
  134427. "connections": {
  134428. "I0": [ "0" ],
  134429. "I1": [ 133 ],
  134430. "I2": [ 5465 ],
  134431. "I3": [ 5417 ],
  134432. "O": [ 5625 ]
  134433. }
  134434. },
  134435. "memctrl_I.so_valid_SB_DFFSR_Q_D_SB_LUT4_O_I2_SB_LUT4_O": {
  134436. "hide_name": 0,
  134437. "type": "SB_LUT4",
  134438. "parameters": {
  134439. "LUT_INIT": "1111000000001111"
  134440. },
  134441. "attributes": {
  134442. "module_not_derived": "00000000000000000000000000000001",
  134443. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134444. },
  134445. "port_directions": {
  134446. "I0": "input",
  134447. "I1": "input",
  134448. "I2": "input",
  134449. "I3": "input",
  134450. "O": "output"
  134451. },
  134452. "connections": {
  134453. "I0": [ "0" ],
  134454. "I1": [ "0" ],
  134455. "I2": [ 123 ],
  134456. "I3": [ 124 ],
  134457. "O": [ 5465 ]
  134458. }
  134459. },
  134460. "memctrl_I.state_SB_DFF_Q": {
  134461. "hide_name": 0,
  134462. "type": "SB_DFF",
  134463. "parameters": {
  134464. },
  134465. "attributes": {
  134466. "module_not_derived": "00000000000000000000000000000001",
  134467. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  134468. },
  134469. "port_directions": {
  134470. "C": "input",
  134471. "D": "input",
  134472. "Q": "output"
  134473. },
  134474. "connections": {
  134475. "C": [ 42 ],
  134476. "D": [ 5470 ],
  134477. "Q": [ 5393 ]
  134478. }
  134479. },
  134480. "memctrl_I.state_SB_DFF_Q_1": {
  134481. "hide_name": 0,
  134482. "type": "SB_DFF",
  134483. "parameters": {
  134484. },
  134485. "attributes": {
  134486. "module_not_derived": "00000000000000000000000000000001",
  134487. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  134488. },
  134489. "port_directions": {
  134490. "C": "input",
  134491. "D": "input",
  134492. "Q": "output"
  134493. },
  134494. "connections": {
  134495. "C": [ 42 ],
  134496. "D": [ 5472 ],
  134497. "Q": [ 5462 ]
  134498. }
  134499. },
  134500. "memctrl_I.state_SB_DFF_Q_2": {
  134501. "hide_name": 0,
  134502. "type": "SB_DFF",
  134503. "parameters": {
  134504. },
  134505. "attributes": {
  134506. "module_not_derived": "00000000000000000000000000000001",
  134507. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  134508. },
  134509. "port_directions": {
  134510. "C": "input",
  134511. "D": "input",
  134512. "Q": "output"
  134513. },
  134514. "connections": {
  134515. "C": [ 42 ],
  134516. "D": [ 5474 ],
  134517. "Q": [ 5451 ]
  134518. }
  134519. },
  134520. "memctrl_I.state_SB_DFF_Q_3": {
  134521. "hide_name": 0,
  134522. "type": "SB_DFF",
  134523. "parameters": {
  134524. },
  134525. "attributes": {
  134526. "module_not_derived": "00000000000000000000000000000001",
  134527. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  134528. },
  134529. "port_directions": {
  134530. "C": "input",
  134531. "D": "input",
  134532. "Q": "output"
  134533. },
  134534. "connections": {
  134535. "C": [ 42 ],
  134536. "D": [ 5469 ],
  134537. "Q": [ 5394 ]
  134538. }
  134539. },
  134540. "memctrl_I.state_SB_DFF_Q_4": {
  134541. "hide_name": 0,
  134542. "type": "SB_DFF",
  134543. "parameters": {
  134544. },
  134545. "attributes": {
  134546. "module_not_derived": "00000000000000000000000000000001",
  134547. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  134548. },
  134549. "port_directions": {
  134550. "C": "input",
  134551. "D": "input",
  134552. "Q": "output"
  134553. },
  134554. "connections": {
  134555. "C": [ 42 ],
  134556. "D": [ 5467 ],
  134557. "Q": [ 5395 ]
  134558. }
  134559. },
  134560. "memctrl_I.wb_ack_SB_DFFSR_Q": {
  134561. "hide_name": 0,
  134562. "type": "SB_DFFSR",
  134563. "parameters": {
  134564. },
  134565. "attributes": {
  134566. "module_not_derived": "00000000000000000000000000000001",
  134567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:314.2-326.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134568. },
  134569. "port_directions": {
  134570. "C": "input",
  134571. "D": "input",
  134572. "Q": "output",
  134573. "R": "input"
  134574. },
  134575. "connections": {
  134576. "C": [ 42 ],
  134577. "D": [ 5626 ],
  134578. "Q": [ 5415 ],
  134579. "R": [ 5627 ]
  134580. }
  134581. },
  134582. "memctrl_I.wb_ack_SB_DFFSR_Q_R_SB_LUT4_O": {
  134583. "hide_name": 0,
  134584. "type": "SB_LUT4",
  134585. "parameters": {
  134586. "LUT_INIT": "1111111111000000"
  134587. },
  134588. "attributes": {
  134589. "module_not_derived": "00000000000000000000000000000001",
  134590. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134591. },
  134592. "port_directions": {
  134593. "I0": "input",
  134594. "I1": "input",
  134595. "I2": "input",
  134596. "I3": "input",
  134597. "O": "output"
  134598. },
  134599. "connections": {
  134600. "I0": [ "0" ],
  134601. "I1": [ 5386 ],
  134602. "I2": [ 5387 ],
  134603. "I3": [ 5628 ],
  134604. "O": [ 5627 ]
  134605. }
  134606. },
  134607. "memctrl_I.wb_ack_SB_DFFSR_Q_R_SB_LUT4_O_I3_SB_LUT4_O": {
  134608. "hide_name": 0,
  134609. "type": "SB_LUT4",
  134610. "parameters": {
  134611. "LUT_INIT": "0000000100000000"
  134612. },
  134613. "attributes": {
  134614. "module_not_derived": "00000000000000000000000000000001",
  134615. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  134616. },
  134617. "port_directions": {
  134618. "I0": "input",
  134619. "I1": "input",
  134620. "I2": "input",
  134621. "I3": "input",
  134622. "O": "output"
  134623. },
  134624. "connections": {
  134625. "I0": [ 697 ],
  134626. "I1": [ 699 ],
  134627. "I2": [ 645 ],
  134628. "I3": [ 5629 ],
  134629. "O": [ 5628 ]
  134630. }
  134631. },
  134632. "memctrl_I.wb_ack_SB_DFFSR_Q_R_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  134633. "hide_name": 0,
  134634. "type": "SB_LUT4",
  134635. "parameters": {
  134636. "LUT_INIT": "0000010000000000"
  134637. },
  134638. "attributes": {
  134639. "module_not_derived": "00000000000000000000000000000001",
  134640. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  134641. },
  134642. "port_directions": {
  134643. "I0": "input",
  134644. "I1": "input",
  134645. "I2": "input",
  134646. "I3": "input",
  134647. "O": "output"
  134648. },
  134649. "connections": {
  134650. "I0": [ 701 ],
  134651. "I1": [ 704 ],
  134652. "I2": [ 469 ],
  134653. "I3": [ 706 ],
  134654. "O": [ 5629 ]
  134655. }
  134656. },
  134657. "memctrl_I.wb_cyc_SB_DFFSR_Q": {
  134658. "hide_name": 0,
  134659. "type": "SB_DFFSR",
  134660. "parameters": {
  134661. },
  134662. "attributes": {
  134663. "module_not_derived": "00000000000000000000000000000001",
  134664. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:294.2-302.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134665. },
  134666. "port_directions": {
  134667. "C": "input",
  134668. "D": "input",
  134669. "Q": "output",
  134670. "R": "input"
  134671. },
  134672. "connections": {
  134673. "C": [ 42 ],
  134674. "D": [ 5630 ],
  134675. "Q": [ 5631 ],
  134676. "R": [ 127 ]
  134677. }
  134678. },
  134679. "memctrl_I.wb_cyc_SB_DFFSR_Q_D_SB_LUT4_O": {
  134680. "hide_name": 0,
  134681. "type": "SB_LUT4",
  134682. "parameters": {
  134683. "LUT_INIT": "0001111100001111"
  134684. },
  134685. "attributes": {
  134686. "module_not_derived": "00000000000000000000000000000001",
  134687. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  134688. },
  134689. "port_directions": {
  134690. "I0": "input",
  134691. "I1": "input",
  134692. "I2": "input",
  134693. "I3": "input",
  134694. "O": "output"
  134695. },
  134696. "connections": {
  134697. "I0": [ 689 ],
  134698. "I1": [ 687 ],
  134699. "I2": [ 5388 ],
  134700. "I3": [ 5632 ],
  134701. "O": [ 5630 ]
  134702. }
  134703. },
  134704. "memctrl_I.wb_cyc_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  134705. "hide_name": 0,
  134706. "type": "SB_LUT4",
  134707. "parameters": {
  134708. "LUT_INIT": "0000110000000000"
  134709. },
  134710. "attributes": {
  134711. "module_not_derived": "00000000000000000000000000000001",
  134712. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  134713. },
  134714. "port_directions": {
  134715. "I0": "input",
  134716. "I1": "input",
  134717. "I2": "input",
  134718. "I3": "input",
  134719. "O": "output"
  134720. },
  134721. "connections": {
  134722. "I0": [ "0" ],
  134723. "I1": [ 890 ],
  134724. "I2": [ 892 ],
  134725. "I3": [ 895 ],
  134726. "O": [ 5632 ]
  134727. }
  134728. },
  134729. "memctrl_I.wb_cyc_SB_LUT4_I3": {
  134730. "hide_name": 0,
  134731. "type": "SB_LUT4",
  134732. "parameters": {
  134733. "LUT_INIT": "1111000011111111"
  134734. },
  134735. "attributes": {
  134736. "module_not_derived": "00000000000000000000000000000001",
  134737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134738. },
  134739. "port_directions": {
  134740. "I0": "input",
  134741. "I1": "input",
  134742. "I2": "input",
  134743. "I3": "input",
  134744. "O": "output"
  134745. },
  134746. "connections": {
  134747. "I0": [ "0" ],
  134748. "I1": [ "0" ],
  134749. "I2": [ 5415 ],
  134750. "I3": [ 5631 ],
  134751. "O": [ 5388 ]
  134752. }
  134753. },
  134754. "memctrl_I.wb_cyc_SB_LUT4_I3_1": {
  134755. "hide_name": 0,
  134756. "type": "SB_LUT4",
  134757. "parameters": {
  134758. "LUT_INIT": "0000111100000000"
  134759. },
  134760. "attributes": {
  134761. "module_not_derived": "00000000000000000000000000000001",
  134762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134763. },
  134764. "port_directions": {
  134765. "I0": "input",
  134766. "I1": "input",
  134767. "I2": "input",
  134768. "I3": "input",
  134769. "O": "output"
  134770. },
  134771. "connections": {
  134772. "I0": [ "0" ],
  134773. "I1": [ "0" ],
  134774. "I2": [ 5415 ],
  134775. "I3": [ 5631 ],
  134776. "O": [ 5626 ]
  134777. }
  134778. },
  134779. "memctrl_I.wb_cyc_SB_LUT4_I3_O_SB_LUT4_I3": {
  134780. "hide_name": 0,
  134781. "type": "SB_LUT4",
  134782. "parameters": {
  134783. "LUT_INIT": "1111111100001111"
  134784. },
  134785. "attributes": {
  134786. "module_not_derived": "00000000000000000000000000000001",
  134787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  134788. },
  134789. "port_directions": {
  134790. "I0": "input",
  134791. "I1": "input",
  134792. "I2": "input",
  134793. "I3": "input",
  134794. "O": "output"
  134795. },
  134796. "connections": {
  134797. "I0": [ "0" ],
  134798. "I1": [ "0" ],
  134799. "I2": [ 704 ],
  134800. "I3": [ 5388 ],
  134801. "O": [ 5633 ]
  134802. }
  134803. },
  134804. "memctrl_I.wb_rdata_SB_DFFSR_Q": {
  134805. "hide_name": 0,
  134806. "type": "SB_DFFSR",
  134807. "parameters": {
  134808. },
  134809. "attributes": {
  134810. "module_not_derived": "00000000000000000000000000000001",
  134811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134812. },
  134813. "port_directions": {
  134814. "C": "input",
  134815. "D": "input",
  134816. "Q": "output",
  134817. "R": "input"
  134818. },
  134819. "connections": {
  134820. "C": [ 42 ],
  134821. "D": [ 5426 ],
  134822. "Q": [ 5634 ],
  134823. "R": [ 5633 ]
  134824. }
  134825. },
  134826. "memctrl_I.wb_rdata_SB_DFFSR_Q_1": {
  134827. "hide_name": 0,
  134828. "type": "SB_DFFSR",
  134829. "parameters": {
  134830. },
  134831. "attributes": {
  134832. "module_not_derived": "00000000000000000000000000000001",
  134833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134834. },
  134835. "port_directions": {
  134836. "C": "input",
  134837. "D": "input",
  134838. "Q": "output",
  134839. "R": "input"
  134840. },
  134841. "connections": {
  134842. "C": [ 42 ],
  134843. "D": [ 5427 ],
  134844. "Q": [ 5635 ],
  134845. "R": [ 5633 ]
  134846. }
  134847. },
  134848. "memctrl_I.wb_rdata_SB_DFFSR_Q_10": {
  134849. "hide_name": 0,
  134850. "type": "SB_DFFSR",
  134851. "parameters": {
  134852. },
  134853. "attributes": {
  134854. "module_not_derived": "00000000000000000000000000000001",
  134855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134856. },
  134857. "port_directions": {
  134858. "C": "input",
  134859. "D": "input",
  134860. "Q": "output",
  134861. "R": "input"
  134862. },
  134863. "connections": {
  134864. "C": [ 42 ],
  134865. "D": [ 5428 ],
  134866. "Q": [ 5636 ],
  134867. "R": [ 5633 ]
  134868. }
  134869. },
  134870. "memctrl_I.wb_rdata_SB_DFFSR_Q_11": {
  134871. "hide_name": 0,
  134872. "type": "SB_DFFSR",
  134873. "parameters": {
  134874. },
  134875. "attributes": {
  134876. "module_not_derived": "00000000000000000000000000000001",
  134877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134878. },
  134879. "port_directions": {
  134880. "C": "input",
  134881. "D": "input",
  134882. "Q": "output",
  134883. "R": "input"
  134884. },
  134885. "connections": {
  134886. "C": [ 42 ],
  134887. "D": [ 5429 ],
  134888. "Q": [ 5637 ],
  134889. "R": [ 5633 ]
  134890. }
  134891. },
  134892. "memctrl_I.wb_rdata_SB_DFFSR_Q_12": {
  134893. "hide_name": 0,
  134894. "type": "SB_DFFSR",
  134895. "parameters": {
  134896. },
  134897. "attributes": {
  134898. "module_not_derived": "00000000000000000000000000000001",
  134899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134900. },
  134901. "port_directions": {
  134902. "C": "input",
  134903. "D": "input",
  134904. "Q": "output",
  134905. "R": "input"
  134906. },
  134907. "connections": {
  134908. "C": [ 42 ],
  134909. "D": [ 5430 ],
  134910. "Q": [ 5638 ],
  134911. "R": [ 5633 ]
  134912. }
  134913. },
  134914. "memctrl_I.wb_rdata_SB_DFFSR_Q_13": {
  134915. "hide_name": 0,
  134916. "type": "SB_DFFSR",
  134917. "parameters": {
  134918. },
  134919. "attributes": {
  134920. "module_not_derived": "00000000000000000000000000000001",
  134921. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134922. },
  134923. "port_directions": {
  134924. "C": "input",
  134925. "D": "input",
  134926. "Q": "output",
  134927. "R": "input"
  134928. },
  134929. "connections": {
  134930. "C": [ 42 ],
  134931. "D": [ 5431 ],
  134932. "Q": [ 5639 ],
  134933. "R": [ 5633 ]
  134934. }
  134935. },
  134936. "memctrl_I.wb_rdata_SB_DFFSR_Q_14": {
  134937. "hide_name": 0,
  134938. "type": "SB_DFFSR",
  134939. "parameters": {
  134940. },
  134941. "attributes": {
  134942. "module_not_derived": "00000000000000000000000000000001",
  134943. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134944. },
  134945. "port_directions": {
  134946. "C": "input",
  134947. "D": "input",
  134948. "Q": "output",
  134949. "R": "input"
  134950. },
  134951. "connections": {
  134952. "C": [ 42 ],
  134953. "D": [ 5432 ],
  134954. "Q": [ 5640 ],
  134955. "R": [ 5633 ]
  134956. }
  134957. },
  134958. "memctrl_I.wb_rdata_SB_DFFSR_Q_15": {
  134959. "hide_name": 0,
  134960. "type": "SB_DFFSR",
  134961. "parameters": {
  134962. },
  134963. "attributes": {
  134964. "module_not_derived": "00000000000000000000000000000001",
  134965. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134966. },
  134967. "port_directions": {
  134968. "C": "input",
  134969. "D": "input",
  134970. "Q": "output",
  134971. "R": "input"
  134972. },
  134973. "connections": {
  134974. "C": [ 42 ],
  134975. "D": [ 5433 ],
  134976. "Q": [ 5641 ],
  134977. "R": [ 5633 ]
  134978. }
  134979. },
  134980. "memctrl_I.wb_rdata_SB_DFFSR_Q_16": {
  134981. "hide_name": 0,
  134982. "type": "SB_DFFSR",
  134983. "parameters": {
  134984. },
  134985. "attributes": {
  134986. "module_not_derived": "00000000000000000000000000000001",
  134987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  134988. },
  134989. "port_directions": {
  134990. "C": "input",
  134991. "D": "input",
  134992. "Q": "output",
  134993. "R": "input"
  134994. },
  134995. "connections": {
  134996. "C": [ 42 ],
  134997. "D": [ 5434 ],
  134998. "Q": [ 5642 ],
  134999. "R": [ 5633 ]
  135000. }
  135001. },
  135002. "memctrl_I.wb_rdata_SB_DFFSR_Q_17": {
  135003. "hide_name": 0,
  135004. "type": "SB_DFFSR",
  135005. "parameters": {
  135006. },
  135007. "attributes": {
  135008. "module_not_derived": "00000000000000000000000000000001",
  135009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135010. },
  135011. "port_directions": {
  135012. "C": "input",
  135013. "D": "input",
  135014. "Q": "output",
  135015. "R": "input"
  135016. },
  135017. "connections": {
  135018. "C": [ 42 ],
  135019. "D": [ 5435 ],
  135020. "Q": [ 5643 ],
  135021. "R": [ 5633 ]
  135022. }
  135023. },
  135024. "memctrl_I.wb_rdata_SB_DFFSR_Q_18": {
  135025. "hide_name": 0,
  135026. "type": "SB_DFFSR",
  135027. "parameters": {
  135028. },
  135029. "attributes": {
  135030. "module_not_derived": "00000000000000000000000000000001",
  135031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135032. },
  135033. "port_directions": {
  135034. "C": "input",
  135035. "D": "input",
  135036. "Q": "output",
  135037. "R": "input"
  135038. },
  135039. "connections": {
  135040. "C": [ 42 ],
  135041. "D": [ 5436 ],
  135042. "Q": [ 5644 ],
  135043. "R": [ 5633 ]
  135044. }
  135045. },
  135046. "memctrl_I.wb_rdata_SB_DFFSR_Q_19": {
  135047. "hide_name": 0,
  135048. "type": "SB_DFFSR",
  135049. "parameters": {
  135050. },
  135051. "attributes": {
  135052. "module_not_derived": "00000000000000000000000000000001",
  135053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135054. },
  135055. "port_directions": {
  135056. "C": "input",
  135057. "D": "input",
  135058. "Q": "output",
  135059. "R": "input"
  135060. },
  135061. "connections": {
  135062. "C": [ 42 ],
  135063. "D": [ 5437 ],
  135064. "Q": [ 5645 ],
  135065. "R": [ 5633 ]
  135066. }
  135067. },
  135068. "memctrl_I.wb_rdata_SB_DFFSR_Q_2": {
  135069. "hide_name": 0,
  135070. "type": "SB_DFFSR",
  135071. "parameters": {
  135072. },
  135073. "attributes": {
  135074. "module_not_derived": "00000000000000000000000000000001",
  135075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135076. },
  135077. "port_directions": {
  135078. "C": "input",
  135079. "D": "input",
  135080. "Q": "output",
  135081. "R": "input"
  135082. },
  135083. "connections": {
  135084. "C": [ 42 ],
  135085. "D": [ 5438 ],
  135086. "Q": [ 5646 ],
  135087. "R": [ 5633 ]
  135088. }
  135089. },
  135090. "memctrl_I.wb_rdata_SB_DFFSR_Q_20": {
  135091. "hide_name": 0,
  135092. "type": "SB_DFFSR",
  135093. "parameters": {
  135094. },
  135095. "attributes": {
  135096. "module_not_derived": "00000000000000000000000000000001",
  135097. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135098. },
  135099. "port_directions": {
  135100. "C": "input",
  135101. "D": "input",
  135102. "Q": "output",
  135103. "R": "input"
  135104. },
  135105. "connections": {
  135106. "C": [ 42 ],
  135107. "D": [ 5439 ],
  135108. "Q": [ 5647 ],
  135109. "R": [ 5633 ]
  135110. }
  135111. },
  135112. "memctrl_I.wb_rdata_SB_DFFSR_Q_21": {
  135113. "hide_name": 0,
  135114. "type": "SB_DFFSR",
  135115. "parameters": {
  135116. },
  135117. "attributes": {
  135118. "module_not_derived": "00000000000000000000000000000001",
  135119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135120. },
  135121. "port_directions": {
  135122. "C": "input",
  135123. "D": "input",
  135124. "Q": "output",
  135125. "R": "input"
  135126. },
  135127. "connections": {
  135128. "C": [ 42 ],
  135129. "D": [ 5440 ],
  135130. "Q": [ 5648 ],
  135131. "R": [ 5633 ]
  135132. }
  135133. },
  135134. "memctrl_I.wb_rdata_SB_DFFSR_Q_22": {
  135135. "hide_name": 0,
  135136. "type": "SB_DFFSR",
  135137. "parameters": {
  135138. },
  135139. "attributes": {
  135140. "module_not_derived": "00000000000000000000000000000001",
  135141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135142. },
  135143. "port_directions": {
  135144. "C": "input",
  135145. "D": "input",
  135146. "Q": "output",
  135147. "R": "input"
  135148. },
  135149. "connections": {
  135150. "C": [ 42 ],
  135151. "D": [ 5497 ],
  135152. "Q": [ 5649 ],
  135153. "R": [ 5388 ]
  135154. }
  135155. },
  135156. "memctrl_I.wb_rdata_SB_DFFSR_Q_23": {
  135157. "hide_name": 0,
  135158. "type": "SB_DFFSR",
  135159. "parameters": {
  135160. },
  135161. "attributes": {
  135162. "module_not_derived": "00000000000000000000000000000001",
  135163. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135164. },
  135165. "port_directions": {
  135166. "C": "input",
  135167. "D": "input",
  135168. "Q": "output",
  135169. "R": "input"
  135170. },
  135171. "connections": {
  135172. "C": [ 42 ],
  135173. "D": [ 5507 ],
  135174. "Q": [ 5650 ],
  135175. "R": [ 5388 ]
  135176. }
  135177. },
  135178. "memctrl_I.wb_rdata_SB_DFFSR_Q_24": {
  135179. "hide_name": 0,
  135180. "type": "SB_DFFSR",
  135181. "parameters": {
  135182. },
  135183. "attributes": {
  135184. "module_not_derived": "00000000000000000000000000000001",
  135185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135186. },
  135187. "port_directions": {
  135188. "C": "input",
  135189. "D": "input",
  135190. "Q": "output",
  135191. "R": "input"
  135192. },
  135193. "connections": {
  135194. "C": [ 42 ],
  135195. "D": [ 5493 ],
  135196. "Q": [ 5651 ],
  135197. "R": [ 5388 ]
  135198. }
  135199. },
  135200. "memctrl_I.wb_rdata_SB_DFFSR_Q_25": {
  135201. "hide_name": 0,
  135202. "type": "SB_DFFSR",
  135203. "parameters": {
  135204. },
  135205. "attributes": {
  135206. "module_not_derived": "00000000000000000000000000000001",
  135207. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135208. },
  135209. "port_directions": {
  135210. "C": "input",
  135211. "D": "input",
  135212. "Q": "output",
  135213. "R": "input"
  135214. },
  135215. "connections": {
  135216. "C": [ 42 ],
  135217. "D": [ 5495 ],
  135218. "Q": [ 5652 ],
  135219. "R": [ 5388 ]
  135220. }
  135221. },
  135222. "memctrl_I.wb_rdata_SB_DFFSR_Q_26": {
  135223. "hide_name": 0,
  135224. "type": "SB_DFFSR",
  135225. "parameters": {
  135226. },
  135227. "attributes": {
  135228. "module_not_derived": "00000000000000000000000000000001",
  135229. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135230. },
  135231. "port_directions": {
  135232. "C": "input",
  135233. "D": "input",
  135234. "Q": "output",
  135235. "R": "input"
  135236. },
  135237. "connections": {
  135238. "C": [ 42 ],
  135239. "D": [ 5509 ],
  135240. "Q": [ 5653 ],
  135241. "R": [ 5388 ]
  135242. }
  135243. },
  135244. "memctrl_I.wb_rdata_SB_DFFSR_Q_27": {
  135245. "hide_name": 0,
  135246. "type": "SB_DFFSR",
  135247. "parameters": {
  135248. },
  135249. "attributes": {
  135250. "module_not_derived": "00000000000000000000000000000001",
  135251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135252. },
  135253. "port_directions": {
  135254. "C": "input",
  135255. "D": "input",
  135256. "Q": "output",
  135257. "R": "input"
  135258. },
  135259. "connections": {
  135260. "C": [ 42 ],
  135261. "D": [ 5499 ],
  135262. "Q": [ 5654 ],
  135263. "R": [ 5388 ]
  135264. }
  135265. },
  135266. "memctrl_I.wb_rdata_SB_DFFSR_Q_28": {
  135267. "hide_name": 0,
  135268. "type": "SB_DFFSR",
  135269. "parameters": {
  135270. },
  135271. "attributes": {
  135272. "module_not_derived": "00000000000000000000000000000001",
  135273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135274. },
  135275. "port_directions": {
  135276. "C": "input",
  135277. "D": "input",
  135278. "Q": "output",
  135279. "R": "input"
  135280. },
  135281. "connections": {
  135282. "C": [ 42 ],
  135283. "D": [ 5501 ],
  135284. "Q": [ 5655 ],
  135285. "R": [ 5388 ]
  135286. }
  135287. },
  135288. "memctrl_I.wb_rdata_SB_DFFSR_Q_29": {
  135289. "hide_name": 0,
  135290. "type": "SB_DFFSR",
  135291. "parameters": {
  135292. },
  135293. "attributes": {
  135294. "module_not_derived": "00000000000000000000000000000001",
  135295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135296. },
  135297. "port_directions": {
  135298. "C": "input",
  135299. "D": "input",
  135300. "Q": "output",
  135301. "R": "input"
  135302. },
  135303. "connections": {
  135304. "C": [ 42 ],
  135305. "D": [ 5503 ],
  135306. "Q": [ 5656 ],
  135307. "R": [ 5388 ]
  135308. }
  135309. },
  135310. "memctrl_I.wb_rdata_SB_DFFSR_Q_3": {
  135311. "hide_name": 0,
  135312. "type": "SB_DFFSR",
  135313. "parameters": {
  135314. },
  135315. "attributes": {
  135316. "module_not_derived": "00000000000000000000000000000001",
  135317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135318. },
  135319. "port_directions": {
  135320. "C": "input",
  135321. "D": "input",
  135322. "Q": "output",
  135323. "R": "input"
  135324. },
  135325. "connections": {
  135326. "C": [ 42 ],
  135327. "D": [ 5441 ],
  135328. "Q": [ 5657 ],
  135329. "R": [ 5633 ]
  135330. }
  135331. },
  135332. "memctrl_I.wb_rdata_SB_DFFSR_Q_30": {
  135333. "hide_name": 0,
  135334. "type": "SB_DFFSR",
  135335. "parameters": {
  135336. },
  135337. "attributes": {
  135338. "module_not_derived": "00000000000000000000000000000001",
  135339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135340. },
  135341. "port_directions": {
  135342. "C": "input",
  135343. "D": "input",
  135344. "Q": "output",
  135345. "R": "input"
  135346. },
  135347. "connections": {
  135348. "C": [ 42 ],
  135349. "D": [ 5505 ],
  135350. "Q": [ 5658 ],
  135351. "R": [ 5388 ]
  135352. }
  135353. },
  135354. "memctrl_I.wb_rdata_SB_DFFSR_Q_31": {
  135355. "hide_name": 0,
  135356. "type": "SB_DFFSR",
  135357. "parameters": {
  135358. },
  135359. "attributes": {
  135360. "module_not_derived": "00000000000000000000000000000001",
  135361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135362. },
  135363. "port_directions": {
  135364. "C": "input",
  135365. "D": "input",
  135366. "Q": "output",
  135367. "R": "input"
  135368. },
  135369. "connections": {
  135370. "C": [ 42 ],
  135371. "D": [ 5511 ],
  135372. "Q": [ 5659 ],
  135373. "R": [ 5388 ]
  135374. }
  135375. },
  135376. "memctrl_I.wb_rdata_SB_DFFSR_Q_4": {
  135377. "hide_name": 0,
  135378. "type": "SB_DFFSR",
  135379. "parameters": {
  135380. },
  135381. "attributes": {
  135382. "module_not_derived": "00000000000000000000000000000001",
  135383. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135384. },
  135385. "port_directions": {
  135386. "C": "input",
  135387. "D": "input",
  135388. "Q": "output",
  135389. "R": "input"
  135390. },
  135391. "connections": {
  135392. "C": [ 42 ],
  135393. "D": [ 5442 ],
  135394. "Q": [ 5660 ],
  135395. "R": [ 5633 ]
  135396. }
  135397. },
  135398. "memctrl_I.wb_rdata_SB_DFFSR_Q_5": {
  135399. "hide_name": 0,
  135400. "type": "SB_DFFSR",
  135401. "parameters": {
  135402. },
  135403. "attributes": {
  135404. "module_not_derived": "00000000000000000000000000000001",
  135405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135406. },
  135407. "port_directions": {
  135408. "C": "input",
  135409. "D": "input",
  135410. "Q": "output",
  135411. "R": "input"
  135412. },
  135413. "connections": {
  135414. "C": [ 42 ],
  135415. "D": [ 5443 ],
  135416. "Q": [ 5661 ],
  135417. "R": [ 5633 ]
  135418. }
  135419. },
  135420. "memctrl_I.wb_rdata_SB_DFFSR_Q_6": {
  135421. "hide_name": 0,
  135422. "type": "SB_DFFSR",
  135423. "parameters": {
  135424. },
  135425. "attributes": {
  135426. "module_not_derived": "00000000000000000000000000000001",
  135427. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135428. },
  135429. "port_directions": {
  135430. "C": "input",
  135431. "D": "input",
  135432. "Q": "output",
  135433. "R": "input"
  135434. },
  135435. "connections": {
  135436. "C": [ 42 ],
  135437. "D": [ 5444 ],
  135438. "Q": [ 5662 ],
  135439. "R": [ 5633 ]
  135440. }
  135441. },
  135442. "memctrl_I.wb_rdata_SB_DFFSR_Q_7": {
  135443. "hide_name": 0,
  135444. "type": "SB_DFFSR",
  135445. "parameters": {
  135446. },
  135447. "attributes": {
  135448. "module_not_derived": "00000000000000000000000000000001",
  135449. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135450. },
  135451. "port_directions": {
  135452. "C": "input",
  135453. "D": "input",
  135454. "Q": "output",
  135455. "R": "input"
  135456. },
  135457. "connections": {
  135458. "C": [ 42 ],
  135459. "D": [ 5445 ],
  135460. "Q": [ 5663 ],
  135461. "R": [ 5633 ]
  135462. }
  135463. },
  135464. "memctrl_I.wb_rdata_SB_DFFSR_Q_8": {
  135465. "hide_name": 0,
  135466. "type": "SB_DFFSR",
  135467. "parameters": {
  135468. },
  135469. "attributes": {
  135470. "module_not_derived": "00000000000000000000000000000001",
  135471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135472. },
  135473. "port_directions": {
  135474. "C": "input",
  135475. "D": "input",
  135476. "Q": "output",
  135477. "R": "input"
  135478. },
  135479. "connections": {
  135480. "C": [ 42 ],
  135481. "D": [ 5446 ],
  135482. "Q": [ 5664 ],
  135483. "R": [ 5633 ]
  135484. }
  135485. },
  135486. "memctrl_I.wb_rdata_SB_DFFSR_Q_9": {
  135487. "hide_name": 0,
  135488. "type": "SB_DFFSR",
  135489. "parameters": {
  135490. },
  135491. "attributes": {
  135492. "module_not_derived": "00000000000000000000000000000001",
  135493. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:373.2-377.52|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  135494. },
  135495. "port_directions": {
  135496. "C": "input",
  135497. "D": "input",
  135498. "Q": "output",
  135499. "R": "input"
  135500. },
  135501. "connections": {
  135502. "C": [ 42 ],
  135503. "D": [ 5447 ],
  135504. "Q": [ 5665 ],
  135505. "R": [ 5633 ]
  135506. }
  135507. },
  135508. "memctrl_I.xfer_cnt_SB_DFFESR_Q": {
  135509. "hide_name": 0,
  135510. "type": "SB_DFFESR",
  135511. "parameters": {
  135512. },
  135513. "attributes": {
  135514. "module_not_derived": "00000000000000000000000000000001",
  135515. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  135516. },
  135517. "port_directions": {
  135518. "C": "input",
  135519. "D": "input",
  135520. "E": "input",
  135521. "Q": "output",
  135522. "R": "input"
  135523. },
  135524. "connections": {
  135525. "C": [ 42 ],
  135526. "D": [ 668 ],
  135527. "E": [ 649 ],
  135528. "Q": [ 652 ],
  135529. "R": [ 133 ]
  135530. }
  135531. },
  135532. "memctrl_I.xfer_cnt_SB_DFFESR_Q_1": {
  135533. "hide_name": 0,
  135534. "type": "SB_DFFESR",
  135535. "parameters": {
  135536. },
  135537. "attributes": {
  135538. "module_not_derived": "00000000000000000000000000000001",
  135539. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  135540. },
  135541. "port_directions": {
  135542. "C": "input",
  135543. "D": "input",
  135544. "E": "input",
  135545. "Q": "output",
  135546. "R": "input"
  135547. },
  135548. "connections": {
  135549. "C": [ 42 ],
  135550. "D": [ 667 ],
  135551. "E": [ 649 ],
  135552. "Q": [ 665 ],
  135553. "R": [ 133 ]
  135554. }
  135555. },
  135556. "memctrl_I.xfer_cnt_SB_DFFESR_Q_2": {
  135557. "hide_name": 0,
  135558. "type": "SB_DFFESR",
  135559. "parameters": {
  135560. },
  135561. "attributes": {
  135562. "module_not_derived": "00000000000000000000000000000001",
  135563. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  135564. },
  135565. "port_directions": {
  135566. "C": "input",
  135567. "D": "input",
  135568. "E": "input",
  135569. "Q": "output",
  135570. "R": "input"
  135571. },
  135572. "connections": {
  135573. "C": [ 42 ],
  135574. "D": [ 664 ],
  135575. "E": [ 649 ],
  135576. "Q": [ 662 ],
  135577. "R": [ 133 ]
  135578. }
  135579. },
  135580. "memctrl_I.xfer_cnt_SB_DFFESR_Q_3": {
  135581. "hide_name": 0,
  135582. "type": "SB_DFFESR",
  135583. "parameters": {
  135584. },
  135585. "attributes": {
  135586. "module_not_derived": "00000000000000000000000000000001",
  135587. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  135588. },
  135589. "port_directions": {
  135590. "C": "input",
  135591. "D": "input",
  135592. "E": "input",
  135593. "Q": "output",
  135594. "R": "input"
  135595. },
  135596. "connections": {
  135597. "C": [ 42 ],
  135598. "D": [ 661 ],
  135599. "E": [ 649 ],
  135600. "Q": [ 659 ],
  135601. "R": [ 133 ]
  135602. }
  135603. },
  135604. "memctrl_I.xfer_cnt_SB_DFFESR_Q_4": {
  135605. "hide_name": 0,
  135606. "type": "SB_DFFESR",
  135607. "parameters": {
  135608. },
  135609. "attributes": {
  135610. "module_not_derived": "00000000000000000000000000000001",
  135611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  135612. },
  135613. "port_directions": {
  135614. "C": "input",
  135615. "D": "input",
  135616. "E": "input",
  135617. "Q": "output",
  135618. "R": "input"
  135619. },
  135620. "connections": {
  135621. "C": [ 42 ],
  135622. "D": [ 669 ],
  135623. "E": [ 649 ],
  135624. "Q": [ 654 ],
  135625. "R": [ 133 ]
  135626. }
  135627. },
  135628. "memctrl_I.xfer_cnt_SB_DFFESS_Q": {
  135629. "hide_name": 0,
  135630. "type": "SB_DFFESS",
  135631. "parameters": {
  135632. },
  135633. "attributes": {
  135634. "module_not_derived": "00000000000000000000000000000001",
  135635. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:25.66-25.119"
  135636. },
  135637. "port_directions": {
  135638. "C": "input",
  135639. "D": "input",
  135640. "E": "input",
  135641. "Q": "output",
  135642. "S": "input"
  135643. },
  135644. "connections": {
  135645. "C": [ 42 ],
  135646. "D": [ 658 ],
  135647. "E": [ 649 ],
  135648. "Q": [ 656 ],
  135649. "S": [ 133 ]
  135650. }
  135651. },
  135652. "memctrl_I.xfer_cnt_SB_DFFESS_Q_1": {
  135653. "hide_name": 0,
  135654. "type": "SB_DFFESS",
  135655. "parameters": {
  135656. },
  135657. "attributes": {
  135658. "module_not_derived": "00000000000000000000000000000001",
  135659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:506.2-510.29|/usr/bin/../share/yosys/ice40/ff_map.v:25.66-25.119"
  135660. },
  135661. "port_directions": {
  135662. "C": "input",
  135663. "D": "input",
  135664. "E": "input",
  135665. "Q": "output",
  135666. "S": "input"
  135667. },
  135668. "connections": {
  135669. "C": [ 42 ],
  135670. "D": [ 655 ],
  135671. "E": [ 649 ],
  135672. "Q": [ 653 ],
  135673. "S": [ 133 ]
  135674. }
  135675. },
  135676. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.genblk1.dff_I": {
  135677. "hide_name": 0,
  135678. "type": "SB_DFF",
  135679. "parameters": {
  135680. },
  135681. "attributes": {
  135682. "BEL": " ",
  135683. "SERDES_ATTR": " ",
  135684. "SERDES_GRP": "00000000000000000000010010100000",
  135685. "dont_touch": "00000000000000000000000000000001",
  135686. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[0].dff_shift_I genblk1.dff_I",
  135687. "keep": "00000000000000000000000000000001",
  135688. "module_not_derived": "00000000000000000000000000000001",
  135689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  135690. },
  135691. "port_directions": {
  135692. "C": "input",
  135693. "D": "input",
  135694. "Q": "output"
  135695. },
  135696. "connections": {
  135697. "C": [ 5666 ],
  135698. "D": [ 5667 ],
  135699. "Q": [ 5668 ]
  135700. }
  135701. },
  135702. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.genblk1.dff_I": {
  135703. "hide_name": 0,
  135704. "type": "SB_DFF",
  135705. "parameters": {
  135706. },
  135707. "attributes": {
  135708. "BEL": " ",
  135709. "SERDES_ATTR": " ",
  135710. "SERDES_GRP": "00000000000000000000010010100001",
  135711. "dont_touch": "00000000000000000000000000000001",
  135712. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[1].dff_shift_I genblk1.dff_I",
  135713. "keep": "00000000000000000000000000000001",
  135714. "module_not_derived": "00000000000000000000000000000001",
  135715. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  135716. },
  135717. "port_directions": {
  135718. "C": "input",
  135719. "D": "input",
  135720. "Q": "output"
  135721. },
  135722. "connections": {
  135723. "C": [ 5666 ],
  135724. "D": [ 5668 ],
  135725. "Q": [ 5669 ]
  135726. }
  135727. },
  135728. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.genblk1.dff_I": {
  135729. "hide_name": 0,
  135730. "type": "SB_DFF",
  135731. "parameters": {
  135732. },
  135733. "attributes": {
  135734. "BEL": " ",
  135735. "SERDES_ATTR": " ",
  135736. "SERDES_GRP": "00000000000000000000010010100010",
  135737. "dont_touch": "00000000000000000000000000000001",
  135738. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[2].dff_shift_I genblk1.dff_I",
  135739. "keep": "00000000000000000000000000000001",
  135740. "module_not_derived": "00000000000000000000000000000001",
  135741. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  135742. },
  135743. "port_directions": {
  135744. "C": "input",
  135745. "D": "input",
  135746. "Q": "output"
  135747. },
  135748. "connections": {
  135749. "C": [ 5666 ],
  135750. "D": [ 5669 ],
  135751. "Q": [ 5670 ]
  135752. }
  135753. },
  135754. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.genblk1.dff_I": {
  135755. "hide_name": 0,
  135756. "type": "SB_DFF",
  135757. "parameters": {
  135758. },
  135759. "attributes": {
  135760. "BEL": " ",
  135761. "SERDES_ATTR": " ",
  135762. "SERDES_GRP": "00000000000000000000010010100011",
  135763. "dont_touch": "00000000000000000000000000000001",
  135764. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[3].dff_shift_I genblk1.dff_I",
  135765. "keep": "00000000000000000000000000000001",
  135766. "module_not_derived": "00000000000000000000000000000001",
  135767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  135768. },
  135769. "port_directions": {
  135770. "C": "input",
  135771. "D": "input",
  135772. "Q": "output"
  135773. },
  135774. "connections": {
  135775. "C": [ 5666 ],
  135776. "D": [ 5670 ],
  135777. "Q": [ 5671 ]
  135778. }
  135779. },
  135780. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  135781. "hide_name": 0,
  135782. "type": "SB_DFFE",
  135783. "parameters": {
  135784. },
  135785. "attributes": {
  135786. "BEL": " ",
  135787. "SERDES_ATTR": " ",
  135788. "SERDES_GRP": "00000000000000000000010010010000",
  135789. "dont_touch": "00000000000000000000000000000001",
  135790. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[0].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  135791. "keep": "00000000000000000000000000000001",
  135792. "module_not_derived": "00000000000000000000000000000001",
  135793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  135794. },
  135795. "port_directions": {
  135796. "C": "input",
  135797. "D": "input",
  135798. "E": "input",
  135799. "Q": "output"
  135800. },
  135801. "connections": {
  135802. "C": [ 5666 ],
  135803. "D": [ 5668 ],
  135804. "E": [ 5672 ],
  135805. "Q": [ 5673 ]
  135806. }
  135807. },
  135808. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  135809. "hide_name": 0,
  135810. "type": "SB_DFFE",
  135811. "parameters": {
  135812. },
  135813. "attributes": {
  135814. "BEL": " ",
  135815. "SERDES_ATTR": " ",
  135816. "SERDES_GRP": "00000000000000000000010010010001",
  135817. "dont_touch": "00000000000000000000000000000001",
  135818. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[1].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  135819. "keep": "00000000000000000000000000000001",
  135820. "module_not_derived": "00000000000000000000000000000001",
  135821. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  135822. },
  135823. "port_directions": {
  135824. "C": "input",
  135825. "D": "input",
  135826. "E": "input",
  135827. "Q": "output"
  135828. },
  135829. "connections": {
  135830. "C": [ 5666 ],
  135831. "D": [ 5669 ],
  135832. "E": [ 5672 ],
  135833. "Q": [ 5674 ]
  135834. }
  135835. },
  135836. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  135837. "hide_name": 0,
  135838. "type": "SB_DFFE",
  135839. "parameters": {
  135840. },
  135841. "attributes": {
  135842. "BEL": " ",
  135843. "SERDES_ATTR": " ",
  135844. "SERDES_GRP": "00000000000000000000010010010010",
  135845. "dont_touch": "00000000000000000000000000000001",
  135846. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[2].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  135847. "keep": "00000000000000000000000000000001",
  135848. "module_not_derived": "00000000000000000000000000000001",
  135849. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  135850. },
  135851. "port_directions": {
  135852. "C": "input",
  135853. "D": "input",
  135854. "E": "input",
  135855. "Q": "output"
  135856. },
  135857. "connections": {
  135858. "C": [ 5666 ],
  135859. "D": [ 5670 ],
  135860. "E": [ 5672 ],
  135861. "Q": [ 5675 ]
  135862. }
  135863. },
  135864. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  135865. "hide_name": 0,
  135866. "type": "SB_DFFE",
  135867. "parameters": {
  135868. },
  135869. "attributes": {
  135870. "BEL": " ",
  135871. "SERDES_ATTR": " ",
  135872. "SERDES_GRP": "00000000000000000000010010010011",
  135873. "dont_touch": "00000000000000000000000000000001",
  135874. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[3].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  135875. "keep": "00000000000000000000000000000001",
  135876. "module_not_derived": "00000000000000000000000000000001",
  135877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  135878. },
  135879. "port_directions": {
  135880. "C": "input",
  135881. "D": "input",
  135882. "E": "input",
  135883. "Q": "output"
  135884. },
  135885. "connections": {
  135886. "C": [ 5666 ],
  135887. "D": [ 5671 ],
  135888. "E": [ 5672 ],
  135889. "Q": [ 5676 ]
  135890. }
  135891. },
  135892. "phy_I.bit[0].isd_I.genblk2.genblk2[0].dff_scap_I.genblk1.dff_I": {
  135893. "hide_name": 0,
  135894. "type": "SB_DFF",
  135895. "parameters": {
  135896. },
  135897. "attributes": {
  135898. "BEL": " ",
  135899. "SERDES_ATTR": " ",
  135900. "SERDES_GRP": "00000000000000000000011010000000",
  135901. "dont_touch": "00000000000000000000000000000001",
  135902. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[0].dff_scap_I genblk1.dff_I",
  135903. "keep": "00000000000000000000000000000001",
  135904. "module_not_derived": "00000000000000000000000000000001",
  135905. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  135906. },
  135907. "port_directions": {
  135908. "C": "input",
  135909. "D": "input",
  135910. "Q": "output"
  135911. },
  135912. "connections": {
  135913. "C": [ 42 ],
  135914. "D": [ 5673 ],
  135915. "Q": [ 5677 ]
  135916. }
  135917. },
  135918. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.genblk1.dff_I": {
  135919. "hide_name": 0,
  135920. "type": "SB_DFF",
  135921. "parameters": {
  135922. },
  135923. "attributes": {
  135924. "BEL": " ",
  135925. "SERDES_ATTR": " ",
  135926. "SERDES_GRP": "00000000000000000000011010000001",
  135927. "dont_touch": "00000000000000000000000000000001",
  135928. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[1].dff_scap_I genblk1.dff_I",
  135929. "keep": "00000000000000000000000000000001",
  135930. "module_not_derived": "00000000000000000000000000000001",
  135931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  135932. },
  135933. "port_directions": {
  135934. "C": "input",
  135935. "D": "input",
  135936. "Q": "output"
  135937. },
  135938. "connections": {
  135939. "C": [ 42 ],
  135940. "D": [ 5674 ],
  135941. "Q": [ 5678 ]
  135942. }
  135943. },
  135944. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2": {
  135945. "hide_name": 0,
  135946. "type": "SB_LUT4",
  135947. "parameters": {
  135948. "LUT_INIT": "1111000011001100"
  135949. },
  135950. "attributes": {
  135951. "module_not_derived": "00000000000000000000000000000001",
  135952. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  135953. },
  135954. "port_directions": {
  135955. "I0": "input",
  135956. "I1": "input",
  135957. "I2": "input",
  135958. "I3": "input",
  135959. "O": "output"
  135960. },
  135961. "connections": {
  135962. "I0": [ "0" ],
  135963. "I1": [ 5679 ],
  135964. "I2": [ 5678 ],
  135965. "I3": [ 5409 ],
  135966. "O": [ 5541 ]
  135967. }
  135968. },
  135969. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O": {
  135970. "hide_name": 0,
  135971. "type": "SB_LUT4",
  135972. "parameters": {
  135973. "LUT_INIT": "1100110011110000"
  135974. },
  135975. "attributes": {
  135976. "module_not_derived": "00000000000000000000000000000001",
  135977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  135978. },
  135979. "port_directions": {
  135980. "I0": "input",
  135981. "I1": "input",
  135982. "I2": "input",
  135983. "I3": "input",
  135984. "O": "output"
  135985. },
  135986. "connections": {
  135987. "I0": [ "0" ],
  135988. "I1": [ 218 ],
  135989. "I2": [ 277 ],
  135990. "I3": [ 5409 ],
  135991. "O": [ 5523 ]
  135992. }
  135993. },
  135994. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_1": {
  135995. "hide_name": 0,
  135996. "type": "SB_LUT4",
  135997. "parameters": {
  135998. "LUT_INIT": "1100110011110000"
  135999. },
  136000. "attributes": {
  136001. "module_not_derived": "00000000000000000000000000000001",
  136002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136003. },
  136004. "port_directions": {
  136005. "I0": "input",
  136006. "I1": "input",
  136007. "I2": "input",
  136008. "I3": "input",
  136009. "O": "output"
  136010. },
  136011. "connections": {
  136012. "I0": [ "0" ],
  136013. "I1": [ 217 ],
  136014. "I2": [ 276 ],
  136015. "I3": [ 5409 ],
  136016. "O": [ 5522 ]
  136017. }
  136018. },
  136019. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_10": {
  136020. "hide_name": 0,
  136021. "type": "SB_LUT4",
  136022. "parameters": {
  136023. "LUT_INIT": "1100110011110000"
  136024. },
  136025. "attributes": {
  136026. "module_not_derived": "00000000000000000000000000000001",
  136027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136028. },
  136029. "port_directions": {
  136030. "I0": "input",
  136031. "I1": "input",
  136032. "I2": "input",
  136033. "I3": "input",
  136034. "O": "output"
  136035. },
  136036. "connections": {
  136037. "I0": [ "0" ],
  136038. "I1": [ 220 ],
  136039. "I2": [ 279 ],
  136040. "I3": [ 5409 ],
  136041. "O": [ 5543 ]
  136042. }
  136043. },
  136044. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_11": {
  136045. "hide_name": 0,
  136046. "type": "SB_LUT4",
  136047. "parameters": {
  136048. "LUT_INIT": "1100110011110000"
  136049. },
  136050. "attributes": {
  136051. "module_not_derived": "00000000000000000000000000000001",
  136052. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136053. },
  136054. "port_directions": {
  136055. "I0": "input",
  136056. "I1": "input",
  136057. "I2": "input",
  136058. "I3": "input",
  136059. "O": "output"
  136060. },
  136061. "connections": {
  136062. "I0": [ "0" ],
  136063. "I1": [ 219 ],
  136064. "I2": [ 278 ],
  136065. "I3": [ 5409 ],
  136066. "O": [ 5542 ]
  136067. }
  136068. },
  136069. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_12": {
  136070. "hide_name": 0,
  136071. "type": "SB_LUT4",
  136072. "parameters": {
  136073. "LUT_INIT": "1100110011110000"
  136074. },
  136075. "attributes": {
  136076. "module_not_derived": "00000000000000000000000000000001",
  136077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136078. },
  136079. "port_directions": {
  136080. "I0": "input",
  136081. "I1": "input",
  136082. "I2": "input",
  136083. "I3": "input",
  136084. "O": "output"
  136085. },
  136086. "connections": {
  136087. "I0": [ "0" ],
  136088. "I1": [ 277 ],
  136089. "I2": [ 215 ],
  136090. "I3": [ 5409 ],
  136091. "O": [ 5539 ]
  136092. }
  136093. },
  136094. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_13": {
  136095. "hide_name": 0,
  136096. "type": "SB_LUT4",
  136097. "parameters": {
  136098. "LUT_INIT": "1100110011110000"
  136099. },
  136100. "attributes": {
  136101. "module_not_derived": "00000000000000000000000000000001",
  136102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136103. },
  136104. "port_directions": {
  136105. "I0": "input",
  136106. "I1": "input",
  136107. "I2": "input",
  136108. "I3": "input",
  136109. "O": "output"
  136110. },
  136111. "connections": {
  136112. "I0": [ "0" ],
  136113. "I1": [ 276 ],
  136114. "I2": [ 214 ],
  136115. "I3": [ 5409 ],
  136116. "O": [ 5528 ]
  136117. }
  136118. },
  136119. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_14": {
  136120. "hide_name": 0,
  136121. "type": "SB_LUT4",
  136122. "parameters": {
  136123. "LUT_INIT": "1100110011110000"
  136124. },
  136125. "attributes": {
  136126. "module_not_derived": "00000000000000000000000000000001",
  136127. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136128. },
  136129. "port_directions": {
  136130. "I0": "input",
  136131. "I1": "input",
  136132. "I2": "input",
  136133. "I3": "input",
  136134. "O": "output"
  136135. },
  136136. "connections": {
  136137. "I0": [ "0" ],
  136138. "I1": [ 275 ],
  136139. "I2": [ 213 ],
  136140. "I3": [ 5409 ],
  136141. "O": [ 5517 ]
  136142. }
  136143. },
  136144. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_15": {
  136145. "hide_name": 0,
  136146. "type": "SB_LUT4",
  136147. "parameters": {
  136148. "LUT_INIT": "1100110011110000"
  136149. },
  136150. "attributes": {
  136151. "module_not_derived": "00000000000000000000000000000001",
  136152. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136153. },
  136154. "port_directions": {
  136155. "I0": "input",
  136156. "I1": "input",
  136157. "I2": "input",
  136158. "I3": "input",
  136159. "O": "output"
  136160. },
  136161. "connections": {
  136162. "I0": [ "0" ],
  136163. "I1": [ 274 ],
  136164. "I2": [ 212 ],
  136165. "I3": [ 5409 ],
  136166. "O": [ 5516 ]
  136167. }
  136168. },
  136169. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_2": {
  136170. "hide_name": 0,
  136171. "type": "SB_LUT4",
  136172. "parameters": {
  136173. "LUT_INIT": "1100110011110000"
  136174. },
  136175. "attributes": {
  136176. "module_not_derived": "00000000000000000000000000000001",
  136177. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136178. },
  136179. "port_directions": {
  136180. "I0": "input",
  136181. "I1": "input",
  136182. "I2": "input",
  136183. "I3": "input",
  136184. "O": "output"
  136185. },
  136186. "connections": {
  136187. "I0": [ "0" ],
  136188. "I1": [ 216 ],
  136189. "I2": [ 275 ],
  136190. "I3": [ 5409 ],
  136191. "O": [ 5521 ]
  136192. }
  136193. },
  136194. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_3": {
  136195. "hide_name": 0,
  136196. "type": "SB_LUT4",
  136197. "parameters": {
  136198. "LUT_INIT": "1100110011110000"
  136199. },
  136200. "attributes": {
  136201. "module_not_derived": "00000000000000000000000000000001",
  136202. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136203. },
  136204. "port_directions": {
  136205. "I0": "input",
  136206. "I1": "input",
  136207. "I2": "input",
  136208. "I3": "input",
  136209. "O": "output"
  136210. },
  136211. "connections": {
  136212. "I0": [ "0" ],
  136213. "I1": [ 225 ],
  136214. "I2": [ 274 ],
  136215. "I3": [ 5409 ],
  136216. "O": [ 5520 ]
  136217. }
  136218. },
  136219. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_4": {
  136220. "hide_name": 0,
  136221. "type": "SB_LUT4",
  136222. "parameters": {
  136223. "LUT_INIT": "1100110011110000"
  136224. },
  136225. "attributes": {
  136226. "module_not_derived": "00000000000000000000000000000001",
  136227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136228. },
  136229. "port_directions": {
  136230. "I0": "input",
  136231. "I1": "input",
  136232. "I2": "input",
  136233. "I3": "input",
  136234. "O": "output"
  136235. },
  136236. "connections": {
  136237. "I0": [ "0" ],
  136238. "I1": [ 273 ],
  136239. "I2": [ 211 ],
  136240. "I3": [ 5409 ],
  136241. "O": [ 5519 ]
  136242. }
  136243. },
  136244. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_5": {
  136245. "hide_name": 0,
  136246. "type": "SB_LUT4",
  136247. "parameters": {
  136248. "LUT_INIT": "1100110011110000"
  136249. },
  136250. "attributes": {
  136251. "module_not_derived": "00000000000000000000000000000001",
  136252. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136253. },
  136254. "port_directions": {
  136255. "I0": "input",
  136256. "I1": "input",
  136257. "I2": "input",
  136258. "I3": "input",
  136259. "O": "output"
  136260. },
  136261. "connections": {
  136262. "I0": [ "0" ],
  136263. "I1": [ 272 ],
  136264. "I2": [ 210 ],
  136265. "I3": [ 5409 ],
  136266. "O": [ 5518 ]
  136267. }
  136268. },
  136269. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_6": {
  136270. "hide_name": 0,
  136271. "type": "SB_LUT4",
  136272. "parameters": {
  136273. "LUT_INIT": "1100110011110000"
  136274. },
  136275. "attributes": {
  136276. "module_not_derived": "00000000000000000000000000000001",
  136277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136278. },
  136279. "port_directions": {
  136280. "I0": "input",
  136281. "I1": "input",
  136282. "I2": "input",
  136283. "I3": "input",
  136284. "O": "output"
  136285. },
  136286. "connections": {
  136287. "I0": [ "0" ],
  136288. "I1": [ 271 ],
  136289. "I2": [ 224 ],
  136290. "I3": [ 5409 ],
  136291. "O": [ 5547 ]
  136292. }
  136293. },
  136294. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_7": {
  136295. "hide_name": 0,
  136296. "type": "SB_LUT4",
  136297. "parameters": {
  136298. "LUT_INIT": "1100110011110000"
  136299. },
  136300. "attributes": {
  136301. "module_not_derived": "00000000000000000000000000000001",
  136302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136303. },
  136304. "port_directions": {
  136305. "I0": "input",
  136306. "I1": "input",
  136307. "I2": "input",
  136308. "I3": "input",
  136309. "O": "output"
  136310. },
  136311. "connections": {
  136312. "I0": [ "0" ],
  136313. "I1": [ 280 ],
  136314. "I2": [ 223 ],
  136315. "I3": [ 5409 ],
  136316. "O": [ 5546 ]
  136317. }
  136318. },
  136319. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_8": {
  136320. "hide_name": 0,
  136321. "type": "SB_LUT4",
  136322. "parameters": {
  136323. "LUT_INIT": "1100110011110000"
  136324. },
  136325. "attributes": {
  136326. "module_not_derived": "00000000000000000000000000000001",
  136327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136328. },
  136329. "port_directions": {
  136330. "I0": "input",
  136331. "I1": "input",
  136332. "I2": "input",
  136333. "I3": "input",
  136334. "O": "output"
  136335. },
  136336. "connections": {
  136337. "I0": [ "0" ],
  136338. "I1": [ 222 ],
  136339. "I2": [ 266 ],
  136340. "I3": [ 5409 ],
  136341. "O": [ 5545 ]
  136342. }
  136343. },
  136344. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O_SB_LUT4_O_9": {
  136345. "hide_name": 0,
  136346. "type": "SB_LUT4",
  136347. "parameters": {
  136348. "LUT_INIT": "1100110011110000"
  136349. },
  136350. "attributes": {
  136351. "module_not_derived": "00000000000000000000000000000001",
  136352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136353. },
  136354. "port_directions": {
  136355. "I0": "input",
  136356. "I1": "input",
  136357. "I2": "input",
  136358. "I3": "input",
  136359. "O": "output"
  136360. },
  136361. "connections": {
  136362. "I0": [ "0" ],
  136363. "I1": [ 221 ],
  136364. "I2": [ 265 ],
  136365. "I3": [ 5409 ],
  136366. "O": [ 5544 ]
  136367. }
  136368. },
  136369. "phy_I.bit[0].isd_I.genblk2.genblk2[2].dff_scap_I.genblk1.dff_I": {
  136370. "hide_name": 0,
  136371. "type": "SB_DFF",
  136372. "parameters": {
  136373. },
  136374. "attributes": {
  136375. "BEL": " ",
  136376. "SERDES_ATTR": " ",
  136377. "SERDES_GRP": "00000000000000000000011010000010",
  136378. "dont_touch": "00000000000000000000000000000001",
  136379. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[2].dff_scap_I genblk1.dff_I",
  136380. "keep": "00000000000000000000000000000001",
  136381. "module_not_derived": "00000000000000000000000000000001",
  136382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136383. },
  136384. "port_directions": {
  136385. "C": "input",
  136386. "D": "input",
  136387. "Q": "output"
  136388. },
  136389. "connections": {
  136390. "C": [ 42 ],
  136391. "D": [ 5675 ],
  136392. "Q": [ 5680 ]
  136393. }
  136394. },
  136395. "phy_I.bit[0].isd_I.genblk2.genblk2[2].dff_scap_I.q_SB_LUT4_I2": {
  136396. "hide_name": 0,
  136397. "type": "SB_LUT4",
  136398. "parameters": {
  136399. "LUT_INIT": "1111000011001100"
  136400. },
  136401. "attributes": {
  136402. "module_not_derived": "00000000000000000000000000000001",
  136403. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136404. },
  136405. "port_directions": {
  136406. "I0": "input",
  136407. "I1": "input",
  136408. "I2": "input",
  136409. "I3": "input",
  136410. "O": "output"
  136411. },
  136412. "connections": {
  136413. "I0": [ "0" ],
  136414. "I1": [ 218 ],
  136415. "I2": [ 5680 ],
  136416. "I3": [ 5409 ],
  136417. "O": [ 5536 ]
  136418. }
  136419. },
  136420. "phy_I.bit[0].isd_I.genblk2.genblk2[3].dff_scap_I.genblk1.dff_I": {
  136421. "hide_name": 0,
  136422. "type": "SB_DFF",
  136423. "parameters": {
  136424. },
  136425. "attributes": {
  136426. "BEL": " ",
  136427. "SERDES_ATTR": " ",
  136428. "SERDES_GRP": "00000000000000000000011010000011",
  136429. "dont_touch": "00000000000000000000000000000001",
  136430. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[3].dff_scap_I genblk1.dff_I",
  136431. "keep": "00000000000000000000000000000001",
  136432. "module_not_derived": "00000000000000000000000000000001",
  136433. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136434. },
  136435. "port_directions": {
  136436. "C": "input",
  136437. "D": "input",
  136438. "Q": "output"
  136439. },
  136440. "connections": {
  136441. "C": [ 42 ],
  136442. "D": [ 5676 ],
  136443. "Q": [ 5681 ]
  136444. }
  136445. },
  136446. "phy_I.bit[0].isd_I.genblk2.genblk2[3].dff_scap_I.q_SB_LUT4_I2": {
  136447. "hide_name": 0,
  136448. "type": "SB_LUT4",
  136449. "parameters": {
  136450. "LUT_INIT": "1111000011001100"
  136451. },
  136452. "attributes": {
  136453. "module_not_derived": "00000000000000000000000000000001",
  136454. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136455. },
  136456. "port_directions": {
  136457. "I0": "input",
  136458. "I1": "input",
  136459. "I2": "input",
  136460. "I3": "input",
  136461. "O": "output"
  136462. },
  136463. "connections": {
  136464. "I0": [ "0" ],
  136465. "I1": [ 273 ],
  136466. "I2": [ 5681 ],
  136467. "I3": [ 5409 ],
  136468. "O": [ 5532 ]
  136469. }
  136470. },
  136471. "phy_I.bit[0].isd_I.genblk2.genblk2[4].dff_scap_I.genblk1.dff_I": {
  136472. "hide_name": 0,
  136473. "type": "SB_DFF",
  136474. "parameters": {
  136475. },
  136476. "attributes": {
  136477. "BEL": " ",
  136478. "SERDES_ATTR": " ",
  136479. "SERDES_GRP": "00000000000000000000011010000100",
  136480. "dont_touch": "00000000000000000000000000000001",
  136481. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[4].dff_scap_I genblk1.dff_I",
  136482. "keep": "00000000000000000000000000000001",
  136483. "module_not_derived": "00000000000000000000000000000001",
  136484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136485. },
  136486. "port_directions": {
  136487. "C": "input",
  136488. "D": "input",
  136489. "Q": "output"
  136490. },
  136491. "connections": {
  136492. "C": [ 42 ],
  136493. "D": [ 5677 ],
  136494. "Q": [ 5682 ]
  136495. }
  136496. },
  136497. "phy_I.bit[0].isd_I.genblk2.genblk2[4].dff_scap_I.q_SB_LUT4_I2": {
  136498. "hide_name": 0,
  136499. "type": "SB_LUT4",
  136500. "parameters": {
  136501. "LUT_INIT": "1111000011001100"
  136502. },
  136503. "attributes": {
  136504. "module_not_derived": "00000000000000000000000000000001",
  136505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136506. },
  136507. "port_directions": {
  136508. "I0": "input",
  136509. "I1": "input",
  136510. "I2": "input",
  136511. "I3": "input",
  136512. "O": "output"
  136513. },
  136514. "connections": {
  136515. "I0": [ "0" ],
  136516. "I1": [ 222 ],
  136517. "I2": [ 5682 ],
  136518. "I3": [ 5409 ],
  136519. "O": [ 5527 ]
  136520. }
  136521. },
  136522. "phy_I.bit[0].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_O": {
  136523. "hide_name": 0,
  136524. "type": "SB_LUT4",
  136525. "parameters": {
  136526. "LUT_INIT": "1111000011001100"
  136527. },
  136528. "attributes": {
  136529. "module_not_derived": "00000000000000000000000000000001",
  136530. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136531. },
  136532. "port_directions": {
  136533. "I0": "input",
  136534. "I1": "input",
  136535. "I2": "input",
  136536. "I3": "input",
  136537. "O": "output"
  136538. },
  136539. "connections": {
  136540. "I0": [ "0" ],
  136541. "I1": [ 5570 ],
  136542. "I2": [ 5596 ],
  136543. "I3": [ 5551 ],
  136544. "O": [ 5683 ]
  136545. }
  136546. },
  136547. "phy_I.bit[0].osd_o_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  136548. "hide_name": 0,
  136549. "type": "SB_DFF",
  136550. "parameters": {
  136551. },
  136552. "attributes": {
  136553. "BEL": " ",
  136554. "SERDES_ATTR": " ",
  136555. "SERDES_GRP": "00000000000000000000000000000000",
  136556. "dont_touch": "00000000000000000000000000000001",
  136557. "hdlname": "phy_I bit[0].osd_o_I genblk1[0].dff_cap_I genblk1.dff_I",
  136558. "keep": "00000000000000000000000000000001",
  136559. "module_not_derived": "00000000000000000000000000000001",
  136560. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136561. },
  136562. "port_directions": {
  136563. "C": "input",
  136564. "D": "input",
  136565. "Q": "output"
  136566. },
  136567. "connections": {
  136568. "C": [ 42 ],
  136569. "D": [ 5683 ],
  136570. "Q": [ 5684 ]
  136571. }
  136572. },
  136573. "phy_I.bit[0].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_O": {
  136574. "hide_name": 0,
  136575. "type": "SB_LUT4",
  136576. "parameters": {
  136577. "LUT_INIT": "1111000011001100"
  136578. },
  136579. "attributes": {
  136580. "module_not_derived": "00000000000000000000000000000001",
  136581. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136582. },
  136583. "port_directions": {
  136584. "I0": "input",
  136585. "I1": "input",
  136586. "I2": "input",
  136587. "I3": "input",
  136588. "O": "output"
  136589. },
  136590. "connections": {
  136591. "I0": [ "0" ],
  136592. "I1": [ 5685 ],
  136593. "I2": [ 5594 ],
  136594. "I3": [ 5551 ],
  136595. "O": [ 5686 ]
  136596. }
  136597. },
  136598. "phy_I.bit[0].osd_o_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  136599. "hide_name": 0,
  136600. "type": "SB_DFF",
  136601. "parameters": {
  136602. },
  136603. "attributes": {
  136604. "BEL": " ",
  136605. "SERDES_ATTR": " ",
  136606. "SERDES_GRP": "00000000000000000000000000000001",
  136607. "dont_touch": "00000000000000000000000000000001",
  136608. "hdlname": "phy_I bit[0].osd_o_I genblk1[1].dff_cap_I genblk1.dff_I",
  136609. "keep": "00000000000000000000000000000001",
  136610. "module_not_derived": "00000000000000000000000000000001",
  136611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136612. },
  136613. "port_directions": {
  136614. "C": "input",
  136615. "D": "input",
  136616. "Q": "output"
  136617. },
  136618. "connections": {
  136619. "C": [ 42 ],
  136620. "D": [ 5686 ],
  136621. "Q": [ 5687 ]
  136622. }
  136623. },
  136624. "phy_I.bit[0].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_O": {
  136625. "hide_name": 0,
  136626. "type": "SB_LUT4",
  136627. "parameters": {
  136628. "LUT_INIT": "1111000011001100"
  136629. },
  136630. "attributes": {
  136631. "module_not_derived": "00000000000000000000000000000001",
  136632. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136633. },
  136634. "port_directions": {
  136635. "I0": "input",
  136636. "I1": "input",
  136637. "I2": "input",
  136638. "I3": "input",
  136639. "O": "output"
  136640. },
  136641. "connections": {
  136642. "I0": [ "0" ],
  136643. "I1": [ 5688 ],
  136644. "I2": [ 5572 ],
  136645. "I3": [ 5551 ],
  136646. "O": [ 5689 ]
  136647. }
  136648. },
  136649. "phy_I.bit[0].osd_o_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  136650. "hide_name": 0,
  136651. "type": "SB_DFF",
  136652. "parameters": {
  136653. },
  136654. "attributes": {
  136655. "BEL": " ",
  136656. "SERDES_ATTR": " ",
  136657. "SERDES_GRP": "00000000000000000000000000000010",
  136658. "dont_touch": "00000000000000000000000000000001",
  136659. "hdlname": "phy_I bit[0].osd_o_I genblk1[2].dff_cap_I genblk1.dff_I",
  136660. "keep": "00000000000000000000000000000001",
  136661. "module_not_derived": "00000000000000000000000000000001",
  136662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136663. },
  136664. "port_directions": {
  136665. "C": "input",
  136666. "D": "input",
  136667. "Q": "output"
  136668. },
  136669. "connections": {
  136670. "C": [ 42 ],
  136671. "D": [ 5689 ],
  136672. "Q": [ 5690 ]
  136673. }
  136674. },
  136675. "phy_I.bit[0].osd_o_I.genblk1[3].dff_cap_I.d_SB_LUT4_O": {
  136676. "hide_name": 0,
  136677. "type": "SB_LUT4",
  136678. "parameters": {
  136679. "LUT_INIT": "1111000011001100"
  136680. },
  136681. "attributes": {
  136682. "module_not_derived": "00000000000000000000000000000001",
  136683. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136684. },
  136685. "port_directions": {
  136686. "I0": "input",
  136687. "I1": "input",
  136688. "I2": "input",
  136689. "I3": "input",
  136690. "O": "output"
  136691. },
  136692. "connections": {
  136693. "I0": [ "0" ],
  136694. "I1": [ 5691 ],
  136695. "I2": [ 5570 ],
  136696. "I3": [ 5551 ],
  136697. "O": [ 5692 ]
  136698. }
  136699. },
  136700. "phy_I.bit[0].osd_o_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  136701. "hide_name": 0,
  136702. "type": "SB_DFF",
  136703. "parameters": {
  136704. },
  136705. "attributes": {
  136706. "BEL": " ",
  136707. "SERDES_ATTR": " ",
  136708. "SERDES_GRP": "00000000000000000000000000000011",
  136709. "dont_touch": "00000000000000000000000000000001",
  136710. "hdlname": "phy_I bit[0].osd_o_I genblk1[3].dff_cap_I genblk1.dff_I",
  136711. "keep": "00000000000000000000000000000001",
  136712. "module_not_derived": "00000000000000000000000000000001",
  136713. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136714. },
  136715. "port_directions": {
  136716. "C": "input",
  136717. "D": "input",
  136718. "Q": "output"
  136719. },
  136720. "connections": {
  136721. "C": [ 42 ],
  136722. "D": [ 5692 ],
  136723. "Q": [ 5693 ]
  136724. }
  136725. },
  136726. "phy_I.bit[0].osd_o_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  136727. "hide_name": 0,
  136728. "type": "SB_LUT4",
  136729. "parameters": {
  136730. "LUT_INIT": "1111000000000000"
  136731. },
  136732. "attributes": {
  136733. "module_not_derived": "00000000000000000000000000000001",
  136734. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  136735. },
  136736. "port_directions": {
  136737. "I0": "input",
  136738. "I1": "input",
  136739. "I2": "input",
  136740. "I3": "input",
  136741. "O": "output"
  136742. },
  136743. "connections": {
  136744. "I0": [ "0" ],
  136745. "I1": [ "0" ],
  136746. "I2": [ 5684 ],
  136747. "I3": [ 5672 ],
  136748. "O": [ 5694 ]
  136749. }
  136750. },
  136751. "phy_I.bit[0].osd_o_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  136752. "hide_name": 0,
  136753. "type": "SB_DFF",
  136754. "parameters": {
  136755. },
  136756. "attributes": {
  136757. "BEL": " ",
  136758. "SERDES_ATTR": " ",
  136759. "SERDES_GRP": "00000000000000000000000000010000",
  136760. "dont_touch": "00000000000000000000000000000001",
  136761. "hdlname": "phy_I bit[0].osd_o_I genblk2[0].dff_shift_I genblk1.dff_I",
  136762. "keep": "00000000000000000000000000000001",
  136763. "module_not_derived": "00000000000000000000000000000001",
  136764. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136765. },
  136766. "port_directions": {
  136767. "C": "input",
  136768. "D": "input",
  136769. "Q": "output"
  136770. },
  136771. "connections": {
  136772. "C": [ 5666 ],
  136773. "D": [ 5694 ],
  136774. "Q": [ 5695 ]
  136775. }
  136776. },
  136777. "phy_I.bit[0].osd_o_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  136778. "hide_name": 0,
  136779. "type": "SB_LUT4",
  136780. "parameters": {
  136781. "LUT_INIT": "1111000011001100"
  136782. },
  136783. "attributes": {
  136784. "module_not_derived": "00000000000000000000000000000001",
  136785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136786. },
  136787. "port_directions": {
  136788. "I0": "input",
  136789. "I1": "input",
  136790. "I2": "input",
  136791. "I3": "input",
  136792. "O": "output"
  136793. },
  136794. "connections": {
  136795. "I0": [ "0" ],
  136796. "I1": [ 5695 ],
  136797. "I2": [ 5687 ],
  136798. "I3": [ 5672 ],
  136799. "O": [ 5696 ]
  136800. }
  136801. },
  136802. "phy_I.bit[0].osd_o_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  136803. "hide_name": 0,
  136804. "type": "SB_DFF",
  136805. "parameters": {
  136806. },
  136807. "attributes": {
  136808. "BEL": " ",
  136809. "SERDES_ATTR": " ",
  136810. "SERDES_GRP": "00000000000000000000000000010001",
  136811. "dont_touch": "00000000000000000000000000000001",
  136812. "hdlname": "phy_I bit[0].osd_o_I genblk2[1].dff_shift_I genblk1.dff_I",
  136813. "keep": "00000000000000000000000000000001",
  136814. "module_not_derived": "00000000000000000000000000000001",
  136815. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136816. },
  136817. "port_directions": {
  136818. "C": "input",
  136819. "D": "input",
  136820. "Q": "output"
  136821. },
  136822. "connections": {
  136823. "C": [ 5666 ],
  136824. "D": [ 5696 ],
  136825. "Q": [ 5697 ]
  136826. }
  136827. },
  136828. "phy_I.bit[0].osd_o_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  136829. "hide_name": 0,
  136830. "type": "SB_LUT4",
  136831. "parameters": {
  136832. "LUT_INIT": "1111000011001100"
  136833. },
  136834. "attributes": {
  136835. "module_not_derived": "00000000000000000000000000000001",
  136836. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136837. },
  136838. "port_directions": {
  136839. "I0": "input",
  136840. "I1": "input",
  136841. "I2": "input",
  136842. "I3": "input",
  136843. "O": "output"
  136844. },
  136845. "connections": {
  136846. "I0": [ "0" ],
  136847. "I1": [ 5697 ],
  136848. "I2": [ 5690 ],
  136849. "I3": [ 5672 ],
  136850. "O": [ 5698 ]
  136851. }
  136852. },
  136853. "phy_I.bit[0].osd_o_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  136854. "hide_name": 0,
  136855. "type": "SB_DFF",
  136856. "parameters": {
  136857. },
  136858. "attributes": {
  136859. "BEL": " ",
  136860. "SERDES_ATTR": " ",
  136861. "SERDES_GRP": "00000000000000000000000000010010",
  136862. "dont_touch": "00000000000000000000000000000001",
  136863. "hdlname": "phy_I bit[0].osd_o_I genblk2[2].dff_shift_I genblk1.dff_I",
  136864. "keep": "00000000000000000000000000000001",
  136865. "module_not_derived": "00000000000000000000000000000001",
  136866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136867. },
  136868. "port_directions": {
  136869. "C": "input",
  136870. "D": "input",
  136871. "Q": "output"
  136872. },
  136873. "connections": {
  136874. "C": [ 5666 ],
  136875. "D": [ 5698 ],
  136876. "Q": [ 5699 ]
  136877. }
  136878. },
  136879. "phy_I.bit[0].osd_o_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  136880. "hide_name": 0,
  136881. "type": "SB_LUT4",
  136882. "parameters": {
  136883. "LUT_INIT": "1111000011001100"
  136884. },
  136885. "attributes": {
  136886. "module_not_derived": "00000000000000000000000000000001",
  136887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136888. },
  136889. "port_directions": {
  136890. "I0": "input",
  136891. "I1": "input",
  136892. "I2": "input",
  136893. "I3": "input",
  136894. "O": "output"
  136895. },
  136896. "connections": {
  136897. "I0": [ "0" ],
  136898. "I1": [ 5699 ],
  136899. "I2": [ 5693 ],
  136900. "I3": [ 5672 ],
  136901. "O": [ 5700 ]
  136902. }
  136903. },
  136904. "phy_I.bit[0].osd_o_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  136905. "hide_name": 0,
  136906. "type": "SB_DFF",
  136907. "parameters": {
  136908. },
  136909. "attributes": {
  136910. "BEL": " ",
  136911. "SERDES_ATTR": " ",
  136912. "SERDES_GRP": "00000000000000000000000000010011",
  136913. "dont_touch": "00000000000000000000000000000001",
  136914. "hdlname": "phy_I bit[0].osd_o_I genblk2[3].dff_shift_I genblk1.dff_I",
  136915. "keep": "00000000000000000000000000000001",
  136916. "module_not_derived": "00000000000000000000000000000001",
  136917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136918. },
  136919. "port_directions": {
  136920. "C": "input",
  136921. "D": "input",
  136922. "Q": "output"
  136923. },
  136924. "connections": {
  136925. "C": [ 5666 ],
  136926. "D": [ 5700 ],
  136927. "Q": [ 5701 ]
  136928. }
  136929. },
  136930. "phy_I.bit[0].osd_oe_I.genblk1[0].dff_cap_I.d_SB_LUT4_O": {
  136931. "hide_name": 0,
  136932. "type": "SB_LUT4",
  136933. "parameters": {
  136934. "LUT_INIT": "1100110000001100"
  136935. },
  136936. "attributes": {
  136937. "module_not_derived": "00000000000000000000000000000001",
  136938. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  136939. },
  136940. "port_directions": {
  136941. "I0": "input",
  136942. "I1": "input",
  136943. "I2": "input",
  136944. "I3": "input",
  136945. "O": "output"
  136946. },
  136947. "connections": {
  136948. "I0": [ "0" ],
  136949. "I1": [ 5461 ],
  136950. "I2": [ 5404 ],
  136951. "I3": [ 5551 ],
  136952. "O": [ 5702 ]
  136953. }
  136954. },
  136955. "phy_I.bit[0].osd_oe_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  136956. "hide_name": 0,
  136957. "type": "SB_DFF",
  136958. "parameters": {
  136959. },
  136960. "attributes": {
  136961. "BEL": " ",
  136962. "SERDES_ATTR": " ",
  136963. "SERDES_GRP": "00000000000000000000001000000000",
  136964. "dont_touch": "00000000000000000000000000000001",
  136965. "hdlname": "phy_I bit[0].osd_oe_I genblk1[0].dff_cap_I genblk1.dff_I",
  136966. "keep": "00000000000000000000000000000001",
  136967. "module_not_derived": "00000000000000000000000000000001",
  136968. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136969. },
  136970. "port_directions": {
  136971. "C": "input",
  136972. "D": "input",
  136973. "Q": "output"
  136974. },
  136975. "connections": {
  136976. "C": [ 42 ],
  136977. "D": [ 5702 ],
  136978. "Q": [ 5703 ]
  136979. }
  136980. },
  136981. "phy_I.bit[0].osd_oe_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  136982. "hide_name": 0,
  136983. "type": "SB_DFF",
  136984. "parameters": {
  136985. },
  136986. "attributes": {
  136987. "BEL": " ",
  136988. "SERDES_ATTR": " ",
  136989. "SERDES_GRP": "00000000000000000000001000000001",
  136990. "dont_touch": "00000000000000000000000000000001",
  136991. "hdlname": "phy_I bit[0].osd_oe_I genblk1[1].dff_cap_I genblk1.dff_I",
  136992. "keep": "00000000000000000000000000000001",
  136993. "module_not_derived": "00000000000000000000000000000001",
  136994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  136995. },
  136996. "port_directions": {
  136997. "C": "input",
  136998. "D": "input",
  136999. "Q": "output"
  137000. },
  137001. "connections": {
  137002. "C": [ 42 ],
  137003. "D": [ 5702 ],
  137004. "Q": [ 5704 ]
  137005. }
  137006. },
  137007. "phy_I.bit[0].osd_oe_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  137008. "hide_name": 0,
  137009. "type": "SB_DFF",
  137010. "parameters": {
  137011. },
  137012. "attributes": {
  137013. "BEL": " ",
  137014. "SERDES_ATTR": " ",
  137015. "SERDES_GRP": "00000000000000000000001000000010",
  137016. "dont_touch": "00000000000000000000000000000001",
  137017. "hdlname": "phy_I bit[0].osd_oe_I genblk1[2].dff_cap_I genblk1.dff_I",
  137018. "keep": "00000000000000000000000000000001",
  137019. "module_not_derived": "00000000000000000000000000000001",
  137020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137021. },
  137022. "port_directions": {
  137023. "C": "input",
  137024. "D": "input",
  137025. "Q": "output"
  137026. },
  137027. "connections": {
  137028. "C": [ 42 ],
  137029. "D": [ 5702 ],
  137030. "Q": [ 5705 ]
  137031. }
  137032. },
  137033. "phy_I.bit[0].osd_oe_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  137034. "hide_name": 0,
  137035. "type": "SB_DFF",
  137036. "parameters": {
  137037. },
  137038. "attributes": {
  137039. "BEL": " ",
  137040. "SERDES_ATTR": " ",
  137041. "SERDES_GRP": "00000000000000000000001000000011",
  137042. "dont_touch": "00000000000000000000000000000001",
  137043. "hdlname": "phy_I bit[0].osd_oe_I genblk1[3].dff_cap_I genblk1.dff_I",
  137044. "keep": "00000000000000000000000000000001",
  137045. "module_not_derived": "00000000000000000000000000000001",
  137046. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137047. },
  137048. "port_directions": {
  137049. "C": "input",
  137050. "D": "input",
  137051. "Q": "output"
  137052. },
  137053. "connections": {
  137054. "C": [ 42 ],
  137055. "D": [ 5702 ],
  137056. "Q": [ 5706 ]
  137057. }
  137058. },
  137059. "phy_I.bit[0].osd_oe_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  137060. "hide_name": 0,
  137061. "type": "SB_LUT4",
  137062. "parameters": {
  137063. "LUT_INIT": "1111000000000000"
  137064. },
  137065. "attributes": {
  137066. "module_not_derived": "00000000000000000000000000000001",
  137067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  137068. },
  137069. "port_directions": {
  137070. "I0": "input",
  137071. "I1": "input",
  137072. "I2": "input",
  137073. "I3": "input",
  137074. "O": "output"
  137075. },
  137076. "connections": {
  137077. "I0": [ "0" ],
  137078. "I1": [ "0" ],
  137079. "I2": [ 5703 ],
  137080. "I3": [ 5672 ],
  137081. "O": [ 5707 ]
  137082. }
  137083. },
  137084. "phy_I.bit[0].osd_oe_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  137085. "hide_name": 0,
  137086. "type": "SB_DFF",
  137087. "parameters": {
  137088. },
  137089. "attributes": {
  137090. "BEL": " ",
  137091. "SERDES_ATTR": " ",
  137092. "SERDES_GRP": "00000000000000000000001000010000",
  137093. "dont_touch": "00000000000000000000000000000001",
  137094. "hdlname": "phy_I bit[0].osd_oe_I genblk2[0].dff_shift_I genblk1.dff_I",
  137095. "keep": "00000000000000000000000000000001",
  137096. "module_not_derived": "00000000000000000000000000000001",
  137097. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137098. },
  137099. "port_directions": {
  137100. "C": "input",
  137101. "D": "input",
  137102. "Q": "output"
  137103. },
  137104. "connections": {
  137105. "C": [ 5666 ],
  137106. "D": [ 5707 ],
  137107. "Q": [ 5708 ]
  137108. }
  137109. },
  137110. "phy_I.bit[0].osd_oe_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  137111. "hide_name": 0,
  137112. "type": "SB_LUT4",
  137113. "parameters": {
  137114. "LUT_INIT": "1111000011001100"
  137115. },
  137116. "attributes": {
  137117. "module_not_derived": "00000000000000000000000000000001",
  137118. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137119. },
  137120. "port_directions": {
  137121. "I0": "input",
  137122. "I1": "input",
  137123. "I2": "input",
  137124. "I3": "input",
  137125. "O": "output"
  137126. },
  137127. "connections": {
  137128. "I0": [ "0" ],
  137129. "I1": [ 5708 ],
  137130. "I2": [ 5704 ],
  137131. "I3": [ 5672 ],
  137132. "O": [ 5709 ]
  137133. }
  137134. },
  137135. "phy_I.bit[0].osd_oe_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  137136. "hide_name": 0,
  137137. "type": "SB_DFF",
  137138. "parameters": {
  137139. },
  137140. "attributes": {
  137141. "BEL": " ",
  137142. "SERDES_ATTR": " ",
  137143. "SERDES_GRP": "00000000000000000000001000010001",
  137144. "dont_touch": "00000000000000000000000000000001",
  137145. "hdlname": "phy_I bit[0].osd_oe_I genblk2[1].dff_shift_I genblk1.dff_I",
  137146. "keep": "00000000000000000000000000000001",
  137147. "module_not_derived": "00000000000000000000000000000001",
  137148. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137149. },
  137150. "port_directions": {
  137151. "C": "input",
  137152. "D": "input",
  137153. "Q": "output"
  137154. },
  137155. "connections": {
  137156. "C": [ 5666 ],
  137157. "D": [ 5709 ],
  137158. "Q": [ 5710 ]
  137159. }
  137160. },
  137161. "phy_I.bit[0].osd_oe_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  137162. "hide_name": 0,
  137163. "type": "SB_LUT4",
  137164. "parameters": {
  137165. "LUT_INIT": "1111000011001100"
  137166. },
  137167. "attributes": {
  137168. "module_not_derived": "00000000000000000000000000000001",
  137169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137170. },
  137171. "port_directions": {
  137172. "I0": "input",
  137173. "I1": "input",
  137174. "I2": "input",
  137175. "I3": "input",
  137176. "O": "output"
  137177. },
  137178. "connections": {
  137179. "I0": [ "0" ],
  137180. "I1": [ 5710 ],
  137181. "I2": [ 5705 ],
  137182. "I3": [ 5672 ],
  137183. "O": [ 5711 ]
  137184. }
  137185. },
  137186. "phy_I.bit[0].osd_oe_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  137187. "hide_name": 0,
  137188. "type": "SB_DFF",
  137189. "parameters": {
  137190. },
  137191. "attributes": {
  137192. "BEL": " ",
  137193. "SERDES_ATTR": " ",
  137194. "SERDES_GRP": "00000000000000000000001000010010",
  137195. "dont_touch": "00000000000000000000000000000001",
  137196. "hdlname": "phy_I bit[0].osd_oe_I genblk2[2].dff_shift_I genblk1.dff_I",
  137197. "keep": "00000000000000000000000000000001",
  137198. "module_not_derived": "00000000000000000000000000000001",
  137199. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137200. },
  137201. "port_directions": {
  137202. "C": "input",
  137203. "D": "input",
  137204. "Q": "output"
  137205. },
  137206. "connections": {
  137207. "C": [ 5666 ],
  137208. "D": [ 5711 ],
  137209. "Q": [ 5712 ]
  137210. }
  137211. },
  137212. "phy_I.bit[0].osd_oe_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  137213. "hide_name": 0,
  137214. "type": "SB_LUT4",
  137215. "parameters": {
  137216. "LUT_INIT": "1111000011001100"
  137217. },
  137218. "attributes": {
  137219. "module_not_derived": "00000000000000000000000000000001",
  137220. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137221. },
  137222. "port_directions": {
  137223. "I0": "input",
  137224. "I1": "input",
  137225. "I2": "input",
  137226. "I3": "input",
  137227. "O": "output"
  137228. },
  137229. "connections": {
  137230. "I0": [ "0" ],
  137231. "I1": [ 5712 ],
  137232. "I2": [ 5706 ],
  137233. "I3": [ 5672 ],
  137234. "O": [ 5713 ]
  137235. }
  137236. },
  137237. "phy_I.bit[0].osd_oe_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  137238. "hide_name": 0,
  137239. "type": "SB_DFF",
  137240. "parameters": {
  137241. },
  137242. "attributes": {
  137243. "BEL": " ",
  137244. "SERDES_ATTR": " ",
  137245. "SERDES_GRP": "00000000000000000000001000010011",
  137246. "dont_touch": "00000000000000000000000000000001",
  137247. "hdlname": "phy_I bit[0].osd_oe_I genblk2[3].dff_shift_I genblk1.dff_I",
  137248. "keep": "00000000000000000000000000000001",
  137249. "module_not_derived": "00000000000000000000000000000001",
  137250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137251. },
  137252. "port_directions": {
  137253. "C": "input",
  137254. "D": "input",
  137255. "Q": "output"
  137256. },
  137257. "connections": {
  137258. "C": [ 5666 ],
  137259. "D": [ 5713 ],
  137260. "Q": [ 5714 ]
  137261. }
  137262. },
  137263. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.genblk1.dff_I": {
  137264. "hide_name": 0,
  137265. "type": "SB_DFF",
  137266. "parameters": {
  137267. },
  137268. "attributes": {
  137269. "BEL": " ",
  137270. "SERDES_ATTR": " ",
  137271. "SERDES_GRP": "00000000000000000001010010100000",
  137272. "dont_touch": "00000000000000000000000000000001",
  137273. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[0].dff_shift_I genblk1.dff_I",
  137274. "keep": "00000000000000000000000000000001",
  137275. "module_not_derived": "00000000000000000000000000000001",
  137276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137277. },
  137278. "port_directions": {
  137279. "C": "input",
  137280. "D": "input",
  137281. "Q": "output"
  137282. },
  137283. "connections": {
  137284. "C": [ 5666 ],
  137285. "D": [ 5715 ],
  137286. "Q": [ 5716 ]
  137287. }
  137288. },
  137289. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.genblk1.dff_I": {
  137290. "hide_name": 0,
  137291. "type": "SB_DFF",
  137292. "parameters": {
  137293. },
  137294. "attributes": {
  137295. "BEL": " ",
  137296. "SERDES_ATTR": " ",
  137297. "SERDES_GRP": "00000000000000000001010010100001",
  137298. "dont_touch": "00000000000000000000000000000001",
  137299. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[1].dff_shift_I genblk1.dff_I",
  137300. "keep": "00000000000000000000000000000001",
  137301. "module_not_derived": "00000000000000000000000000000001",
  137302. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137303. },
  137304. "port_directions": {
  137305. "C": "input",
  137306. "D": "input",
  137307. "Q": "output"
  137308. },
  137309. "connections": {
  137310. "C": [ 5666 ],
  137311. "D": [ 5716 ],
  137312. "Q": [ 5717 ]
  137313. }
  137314. },
  137315. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.genblk1.dff_I": {
  137316. "hide_name": 0,
  137317. "type": "SB_DFF",
  137318. "parameters": {
  137319. },
  137320. "attributes": {
  137321. "BEL": " ",
  137322. "SERDES_ATTR": " ",
  137323. "SERDES_GRP": "00000000000000000001010010100010",
  137324. "dont_touch": "00000000000000000000000000000001",
  137325. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[2].dff_shift_I genblk1.dff_I",
  137326. "keep": "00000000000000000000000000000001",
  137327. "module_not_derived": "00000000000000000000000000000001",
  137328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137329. },
  137330. "port_directions": {
  137331. "C": "input",
  137332. "D": "input",
  137333. "Q": "output"
  137334. },
  137335. "connections": {
  137336. "C": [ 5666 ],
  137337. "D": [ 5717 ],
  137338. "Q": [ 5718 ]
  137339. }
  137340. },
  137341. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.genblk1.dff_I": {
  137342. "hide_name": 0,
  137343. "type": "SB_DFF",
  137344. "parameters": {
  137345. },
  137346. "attributes": {
  137347. "BEL": " ",
  137348. "SERDES_ATTR": " ",
  137349. "SERDES_GRP": "00000000000000000001010010100011",
  137350. "dont_touch": "00000000000000000000000000000001",
  137351. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[3].dff_shift_I genblk1.dff_I",
  137352. "keep": "00000000000000000000000000000001",
  137353. "module_not_derived": "00000000000000000000000000000001",
  137354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137355. },
  137356. "port_directions": {
  137357. "C": "input",
  137358. "D": "input",
  137359. "Q": "output"
  137360. },
  137361. "connections": {
  137362. "C": [ 5666 ],
  137363. "D": [ 5718 ],
  137364. "Q": [ 5719 ]
  137365. }
  137366. },
  137367. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  137368. "hide_name": 0,
  137369. "type": "SB_DFFE",
  137370. "parameters": {
  137371. },
  137372. "attributes": {
  137373. "BEL": " ",
  137374. "SERDES_ATTR": " ",
  137375. "SERDES_GRP": "00000000000000000001010010010000",
  137376. "dont_touch": "00000000000000000000000000000001",
  137377. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[0].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  137378. "keep": "00000000000000000000000000000001",
  137379. "module_not_derived": "00000000000000000000000000000001",
  137380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  137381. },
  137382. "port_directions": {
  137383. "C": "input",
  137384. "D": "input",
  137385. "E": "input",
  137386. "Q": "output"
  137387. },
  137388. "connections": {
  137389. "C": [ 5666 ],
  137390. "D": [ 5716 ],
  137391. "E": [ 5672 ],
  137392. "Q": [ 5720 ]
  137393. }
  137394. },
  137395. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  137396. "hide_name": 0,
  137397. "type": "SB_DFFE",
  137398. "parameters": {
  137399. },
  137400. "attributes": {
  137401. "BEL": " ",
  137402. "SERDES_ATTR": " ",
  137403. "SERDES_GRP": "00000000000000000001010010010001",
  137404. "dont_touch": "00000000000000000000000000000001",
  137405. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[1].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  137406. "keep": "00000000000000000000000000000001",
  137407. "module_not_derived": "00000000000000000000000000000001",
  137408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  137409. },
  137410. "port_directions": {
  137411. "C": "input",
  137412. "D": "input",
  137413. "E": "input",
  137414. "Q": "output"
  137415. },
  137416. "connections": {
  137417. "C": [ 5666 ],
  137418. "D": [ 5717 ],
  137419. "E": [ 5672 ],
  137420. "Q": [ 5721 ]
  137421. }
  137422. },
  137423. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  137424. "hide_name": 0,
  137425. "type": "SB_DFFE",
  137426. "parameters": {
  137427. },
  137428. "attributes": {
  137429. "BEL": " ",
  137430. "SERDES_ATTR": " ",
  137431. "SERDES_GRP": "00000000000000000001010010010010",
  137432. "dont_touch": "00000000000000000000000000000001",
  137433. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[2].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  137434. "keep": "00000000000000000000000000000001",
  137435. "module_not_derived": "00000000000000000000000000000001",
  137436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  137437. },
  137438. "port_directions": {
  137439. "C": "input",
  137440. "D": "input",
  137441. "E": "input",
  137442. "Q": "output"
  137443. },
  137444. "connections": {
  137445. "C": [ 5666 ],
  137446. "D": [ 5718 ],
  137447. "E": [ 5672 ],
  137448. "Q": [ 5722 ]
  137449. }
  137450. },
  137451. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  137452. "hide_name": 0,
  137453. "type": "SB_DFFE",
  137454. "parameters": {
  137455. },
  137456. "attributes": {
  137457. "BEL": " ",
  137458. "SERDES_ATTR": " ",
  137459. "SERDES_GRP": "00000000000000000001010010010011",
  137460. "dont_touch": "00000000000000000000000000000001",
  137461. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[3].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  137462. "keep": "00000000000000000000000000000001",
  137463. "module_not_derived": "00000000000000000000000000000001",
  137464. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  137465. },
  137466. "port_directions": {
  137467. "C": "input",
  137468. "D": "input",
  137469. "E": "input",
  137470. "Q": "output"
  137471. },
  137472. "connections": {
  137473. "C": [ 5666 ],
  137474. "D": [ 5719 ],
  137475. "E": [ 5672 ],
  137476. "Q": [ 5723 ]
  137477. }
  137478. },
  137479. "phy_I.bit[1].isd_I.genblk2.genblk2[0].dff_scap_I.genblk1.dff_I": {
  137480. "hide_name": 0,
  137481. "type": "SB_DFF",
  137482. "parameters": {
  137483. },
  137484. "attributes": {
  137485. "BEL": " ",
  137486. "SERDES_ATTR": " ",
  137487. "SERDES_GRP": "00000000000000000001011010000000",
  137488. "dont_touch": "00000000000000000000000000000001",
  137489. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[0].dff_scap_I genblk1.dff_I",
  137490. "keep": "00000000000000000000000000000001",
  137491. "module_not_derived": "00000000000000000000000000000001",
  137492. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137493. },
  137494. "port_directions": {
  137495. "C": "input",
  137496. "D": "input",
  137497. "Q": "output"
  137498. },
  137499. "connections": {
  137500. "C": [ 42 ],
  137501. "D": [ 5720 ],
  137502. "Q": [ 5724 ]
  137503. }
  137504. },
  137505. "phy_I.bit[1].isd_I.genblk2.genblk2[1].dff_scap_I.genblk1.dff_I": {
  137506. "hide_name": 0,
  137507. "type": "SB_DFF",
  137508. "parameters": {
  137509. },
  137510. "attributes": {
  137511. "BEL": " ",
  137512. "SERDES_ATTR": " ",
  137513. "SERDES_GRP": "00000000000000000001011010000001",
  137514. "dont_touch": "00000000000000000000000000000001",
  137515. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[1].dff_scap_I genblk1.dff_I",
  137516. "keep": "00000000000000000000000000000001",
  137517. "module_not_derived": "00000000000000000000000000000001",
  137518. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137519. },
  137520. "port_directions": {
  137521. "C": "input",
  137522. "D": "input",
  137523. "Q": "output"
  137524. },
  137525. "connections": {
  137526. "C": [ 42 ],
  137527. "D": [ 5721 ],
  137528. "Q": [ 5679 ]
  137529. }
  137530. },
  137531. "phy_I.bit[1].isd_I.genblk2.genblk2[2].dff_scap_I.genblk1.dff_I": {
  137532. "hide_name": 0,
  137533. "type": "SB_DFF",
  137534. "parameters": {
  137535. },
  137536. "attributes": {
  137537. "BEL": " ",
  137538. "SERDES_ATTR": " ",
  137539. "SERDES_GRP": "00000000000000000001011010000010",
  137540. "dont_touch": "00000000000000000000000000000001",
  137541. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[2].dff_scap_I genblk1.dff_I",
  137542. "keep": "00000000000000000000000000000001",
  137543. "module_not_derived": "00000000000000000000000000000001",
  137544. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137545. },
  137546. "port_directions": {
  137547. "C": "input",
  137548. "D": "input",
  137549. "Q": "output"
  137550. },
  137551. "connections": {
  137552. "C": [ 42 ],
  137553. "D": [ 5722 ],
  137554. "Q": [ 5725 ]
  137555. }
  137556. },
  137557. "phy_I.bit[1].isd_I.genblk2.genblk2[2].dff_scap_I.q_SB_LUT4_I1": {
  137558. "hide_name": 0,
  137559. "type": "SB_LUT4",
  137560. "parameters": {
  137561. "LUT_INIT": "1111000011001100"
  137562. },
  137563. "attributes": {
  137564. "module_not_derived": "00000000000000000000000000000001",
  137565. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137566. },
  137567. "port_directions": {
  137568. "I0": "input",
  137569. "I1": "input",
  137570. "I2": "input",
  137571. "I3": "input",
  137572. "O": "output"
  137573. },
  137574. "connections": {
  137575. "I0": [ "0" ],
  137576. "I1": [ 5725 ],
  137577. "I2": [ 5679 ],
  137578. "I3": [ 5409 ],
  137579. "O": [ 5540 ]
  137580. }
  137581. },
  137582. "phy_I.bit[1].isd_I.genblk2.genblk2[2].dff_scap_I.q_SB_LUT4_I2": {
  137583. "hide_name": 0,
  137584. "type": "SB_LUT4",
  137585. "parameters": {
  137586. "LUT_INIT": "1111000011001100"
  137587. },
  137588. "attributes": {
  137589. "module_not_derived": "00000000000000000000000000000001",
  137590. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137591. },
  137592. "port_directions": {
  137593. "I0": "input",
  137594. "I1": "input",
  137595. "I2": "input",
  137596. "I3": "input",
  137597. "O": "output"
  137598. },
  137599. "connections": {
  137600. "I0": [ "0" ],
  137601. "I1": [ 217 ],
  137602. "I2": [ 5725 ],
  137603. "I3": [ 5409 ],
  137604. "O": [ 5535 ]
  137605. }
  137606. },
  137607. "phy_I.bit[1].isd_I.genblk2.genblk2[3].dff_scap_I.genblk1.dff_I": {
  137608. "hide_name": 0,
  137609. "type": "SB_DFF",
  137610. "parameters": {
  137611. },
  137612. "attributes": {
  137613. "BEL": " ",
  137614. "SERDES_ATTR": " ",
  137615. "SERDES_GRP": "00000000000000000001011010000011",
  137616. "dont_touch": "00000000000000000000000000000001",
  137617. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[3].dff_scap_I genblk1.dff_I",
  137618. "keep": "00000000000000000000000000000001",
  137619. "module_not_derived": "00000000000000000000000000000001",
  137620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137621. },
  137622. "port_directions": {
  137623. "C": "input",
  137624. "D": "input",
  137625. "Q": "output"
  137626. },
  137627. "connections": {
  137628. "C": [ 42 ],
  137629. "D": [ 5723 ],
  137630. "Q": [ 5726 ]
  137631. }
  137632. },
  137633. "phy_I.bit[1].isd_I.genblk2.genblk2[3].dff_scap_I.q_SB_LUT4_I2": {
  137634. "hide_name": 0,
  137635. "type": "SB_LUT4",
  137636. "parameters": {
  137637. "LUT_INIT": "1111000011001100"
  137638. },
  137639. "attributes": {
  137640. "module_not_derived": "00000000000000000000000000000001",
  137641. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137642. },
  137643. "port_directions": {
  137644. "I0": "input",
  137645. "I1": "input",
  137646. "I2": "input",
  137647. "I3": "input",
  137648. "O": "output"
  137649. },
  137650. "connections": {
  137651. "I0": [ "0" ],
  137652. "I1": [ 272 ],
  137653. "I2": [ 5726 ],
  137654. "I3": [ 5409 ],
  137655. "O": [ 5531 ]
  137656. }
  137657. },
  137658. "phy_I.bit[1].isd_I.genblk2.genblk2[4].dff_scap_I.genblk1.dff_I": {
  137659. "hide_name": 0,
  137660. "type": "SB_DFF",
  137661. "parameters": {
  137662. },
  137663. "attributes": {
  137664. "BEL": " ",
  137665. "SERDES_ATTR": " ",
  137666. "SERDES_GRP": "00000000000000000001011010000100",
  137667. "dont_touch": "00000000000000000000000000000001",
  137668. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[4].dff_scap_I genblk1.dff_I",
  137669. "keep": "00000000000000000000000000000001",
  137670. "module_not_derived": "00000000000000000000000000000001",
  137671. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137672. },
  137673. "port_directions": {
  137674. "C": "input",
  137675. "D": "input",
  137676. "Q": "output"
  137677. },
  137678. "connections": {
  137679. "C": [ 42 ],
  137680. "D": [ 5724 ],
  137681. "Q": [ 5727 ]
  137682. }
  137683. },
  137684. "phy_I.bit[1].isd_I.genblk2.genblk2[4].dff_scap_I.q_SB_LUT4_I2": {
  137685. "hide_name": 0,
  137686. "type": "SB_LUT4",
  137687. "parameters": {
  137688. "LUT_INIT": "1111000011001100"
  137689. },
  137690. "attributes": {
  137691. "module_not_derived": "00000000000000000000000000000001",
  137692. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137693. },
  137694. "port_directions": {
  137695. "I0": "input",
  137696. "I1": "input",
  137697. "I2": "input",
  137698. "I3": "input",
  137699. "O": "output"
  137700. },
  137701. "connections": {
  137702. "I0": [ "0" ],
  137703. "I1": [ 221 ],
  137704. "I2": [ 5727 ],
  137705. "I3": [ 5409 ],
  137706. "O": [ 5526 ]
  137707. }
  137708. },
  137709. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_DFF_Q": {
  137710. "hide_name": 0,
  137711. "type": "SB_DFF",
  137712. "parameters": {
  137713. },
  137714. "attributes": {
  137715. "module_not_derived": "00000000000000000000000000000001",
  137716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  137717. },
  137718. "port_directions": {
  137719. "C": "input",
  137720. "D": "input",
  137721. "Q": "output"
  137722. },
  137723. "connections": {
  137724. "C": [ 42 ],
  137725. "D": [ 5728 ],
  137726. "Q": [ 5729 ]
  137727. }
  137728. },
  137729. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I0": {
  137730. "hide_name": 0,
  137731. "type": "SB_LUT4",
  137732. "parameters": {
  137733. "LUT_INIT": "1111111100110101"
  137734. },
  137735. "attributes": {
  137736. "module_not_derived": "00000000000000000000000000000001",
  137737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  137738. },
  137739. "port_directions": {
  137740. "I0": "input",
  137741. "I1": "input",
  137742. "I2": "input",
  137743. "I3": "input",
  137744. "O": "output"
  137745. },
  137746. "connections": {
  137747. "I0": [ 5729 ],
  137748. "I1": [ 5582 ],
  137749. "I2": [ 5551 ],
  137750. "I3": [ 5390 ],
  137751. "O": [ 5730 ]
  137752. }
  137753. },
  137754. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  137755. "hide_name": 0,
  137756. "type": "SB_LUT4",
  137757. "parameters": {
  137758. "LUT_INIT": "0001010100111111"
  137759. },
  137760. "attributes": {
  137761. "module_not_derived": "00000000000000000000000000000001",
  137762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  137763. },
  137764. "port_directions": {
  137765. "I0": "input",
  137766. "I1": "input",
  137767. "I2": "input",
  137768. "I3": "input",
  137769. "O": "output"
  137770. },
  137771. "connections": {
  137772. "I0": [ 254 ],
  137773. "I1": [ 5731 ],
  137774. "I2": [ 5418 ],
  137775. "I3": [ 122 ],
  137776. "O": [ 5732 ]
  137777. }
  137778. },
  137779. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1": {
  137780. "hide_name": 0,
  137781. "type": "SB_LUT4",
  137782. "parameters": {
  137783. "LUT_INIT": "1100101000000000"
  137784. },
  137785. "attributes": {
  137786. "module_not_derived": "00000000000000000000000000000001",
  137787. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  137788. },
  137789. "port_directions": {
  137790. "I0": "input",
  137791. "I1": "input",
  137792. "I2": "input",
  137793. "I3": "input",
  137794. "O": "output"
  137795. },
  137796. "connections": {
  137797. "I0": [ 484 ],
  137798. "I1": [ 368 ],
  137799. "I2": [ 647 ],
  137800. "I3": [ 5419 ],
  137801. "O": [ 5733 ]
  137802. }
  137803. },
  137804. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  137805. "hide_name": 0,
  137806. "type": "SB_DFFER",
  137807. "parameters": {
  137808. },
  137809. "attributes": {
  137810. "module_not_derived": "00000000000000000000000000000001",
  137811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  137812. },
  137813. "port_directions": {
  137814. "C": "input",
  137815. "D": "input",
  137816. "E": "input",
  137817. "Q": "output",
  137818. "R": "input"
  137819. },
  137820. "connections": {
  137821. "C": [ 42 ],
  137822. "D": [ 105 ],
  137823. "E": [ 5392 ],
  137824. "Q": [ 5731 ],
  137825. "R": [ 127 ]
  137826. }
  137827. },
  137828. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  137829. "hide_name": 0,
  137830. "type": "SB_DFF",
  137831. "parameters": {
  137832. },
  137833. "attributes": {
  137834. "BEL": " ",
  137835. "SERDES_ATTR": " ",
  137836. "SERDES_GRP": "00000000000000000001000000000000",
  137837. "dont_touch": "00000000000000000000000000000001",
  137838. "hdlname": "phy_I bit[1].osd_o_I genblk1[0].dff_cap_I genblk1.dff_I",
  137839. "keep": "00000000000000000000000000000001",
  137840. "module_not_derived": "00000000000000000000000000000001",
  137841. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  137842. },
  137843. "port_directions": {
  137844. "C": "input",
  137845. "D": "input",
  137846. "Q": "output"
  137847. },
  137848. "connections": {
  137849. "C": [ 42 ],
  137850. "D": [ 5729 ],
  137851. "Q": [ 5734 ]
  137852. }
  137853. },
  137854. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_DFF_Q": {
  137855. "hide_name": 0,
  137856. "type": "SB_DFF",
  137857. "parameters": {
  137858. },
  137859. "attributes": {
  137860. "module_not_derived": "00000000000000000000000000000001",
  137861. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  137862. },
  137863. "port_directions": {
  137864. "C": "input",
  137865. "D": "input",
  137866. "Q": "output"
  137867. },
  137868. "connections": {
  137869. "C": [ 42 ],
  137870. "D": [ 5735 ],
  137871. "Q": [ 5736 ]
  137872. }
  137873. },
  137874. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0": {
  137875. "hide_name": 0,
  137876. "type": "SB_LUT4",
  137877. "parameters": {
  137878. "LUT_INIT": "1111111100110101"
  137879. },
  137880. "attributes": {
  137881. "module_not_derived": "00000000000000000000000000000001",
  137882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  137883. },
  137884. "port_directions": {
  137885. "I0": "input",
  137886. "I1": "input",
  137887. "I2": "input",
  137888. "I3": "input",
  137889. "O": "output"
  137890. },
  137891. "connections": {
  137892. "I0": [ 5736 ],
  137893. "I1": [ 5574 ],
  137894. "I2": [ 5551 ],
  137895. "I3": [ 5390 ],
  137896. "O": [ 5737 ]
  137897. }
  137898. },
  137899. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1": {
  137900. "hide_name": 0,
  137901. "type": "SB_LUT4",
  137902. "parameters": {
  137903. "LUT_INIT": "1111111100111111"
  137904. },
  137905. "attributes": {
  137906. "module_not_derived": "00000000000000000000000000000001",
  137907. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137908. },
  137909. "port_directions": {
  137910. "I0": "input",
  137911. "I1": "input",
  137912. "I2": "input",
  137913. "I3": "input",
  137914. "O": "output"
  137915. },
  137916. "connections": {
  137917. "I0": [ "0" ],
  137918. "I1": [ 5737 ],
  137919. "I2": [ 5738 ],
  137920. "I3": [ 5739 ],
  137921. "O": [ 5740 ]
  137922. }
  137923. },
  137924. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3_SB_LUT4_I3": {
  137925. "hide_name": 0,
  137926. "type": "SB_LUT4",
  137927. "parameters": {
  137928. "LUT_INIT": "0000110000000000"
  137929. },
  137930. "attributes": {
  137931. "module_not_derived": "00000000000000000000000000000001",
  137932. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  137933. },
  137934. "port_directions": {
  137935. "I0": "input",
  137936. "I1": "input",
  137937. "I2": "input",
  137938. "I3": "input",
  137939. "O": "output"
  137940. },
  137941. "connections": {
  137942. "I0": [ "0" ],
  137943. "I1": [ 123 ],
  137944. "I2": [ 124 ],
  137945. "I3": [ 5739 ],
  137946. "O": [ 5741 ]
  137947. }
  137948. },
  137949. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  137950. "hide_name": 0,
  137951. "type": "SB_LUT4",
  137952. "parameters": {
  137953. "LUT_INIT": "0001001101011111"
  137954. },
  137955. "attributes": {
  137956. "module_not_derived": "00000000000000000000000000000001",
  137957. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  137958. },
  137959. "port_directions": {
  137960. "I0": "input",
  137961. "I1": "input",
  137962. "I2": "input",
  137963. "I3": "input",
  137964. "O": "output"
  137965. },
  137966. "connections": {
  137967. "I0": [ 5594 ],
  137968. "I1": [ 5742 ],
  137969. "I2": [ 5622 ],
  137970. "I3": [ 5418 ],
  137971. "O": [ 5743 ]
  137972. }
  137973. },
  137974. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3_SB_LUT4_I3_O_SB_LUT4_O_1": {
  137975. "hide_name": 0,
  137976. "type": "SB_LUT4",
  137977. "parameters": {
  137978. "LUT_INIT": "0001010100111111"
  137979. },
  137980. "attributes": {
  137981. "module_not_derived": "00000000000000000000000000000001",
  137982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  137983. },
  137984. "port_directions": {
  137985. "I0": "input",
  137986. "I1": "input",
  137987. "I2": "input",
  137988. "I3": "input",
  137989. "O": "output"
  137990. },
  137991. "connections": {
  137992. "I0": [ 180 ],
  137993. "I1": [ 5576 ],
  137994. "I2": [ 5613 ],
  137995. "I3": [ 122 ],
  137996. "O": [ 5744 ]
  137997. }
  137998. },
  137999. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3_SB_LUT4_I3_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  138000. "hide_name": 0,
  138001. "type": "SB_DFFER",
  138002. "parameters": {
  138003. },
  138004. "attributes": {
  138005. "module_not_derived": "00000000000000000000000000000001",
  138006. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  138007. },
  138008. "port_directions": {
  138009. "C": "input",
  138010. "D": "input",
  138011. "E": "input",
  138012. "Q": "output",
  138013. "R": "input"
  138014. },
  138015. "connections": {
  138016. "C": [ 42 ],
  138017. "D": [ 96 ],
  138018. "E": [ 5392 ],
  138019. "Q": [ 5742 ],
  138020. "R": [ 127 ]
  138021. }
  138022. },
  138023. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  138024. "hide_name": 0,
  138025. "type": "SB_LUT4",
  138026. "parameters": {
  138027. "LUT_INIT": "0001010100111111"
  138028. },
  138029. "attributes": {
  138030. "module_not_derived": "00000000000000000000000000000001",
  138031. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  138032. },
  138033. "port_directions": {
  138034. "I0": "input",
  138035. "I1": "input",
  138036. "I2": "input",
  138037. "I3": "input",
  138038. "O": "output"
  138039. },
  138040. "connections": {
  138041. "I0": [ 181 ],
  138042. "I1": [ 5745 ],
  138043. "I2": [ 5418 ],
  138044. "I3": [ 122 ],
  138045. "O": [ 5738 ]
  138046. }
  138047. },
  138048. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  138049. "hide_name": 0,
  138050. "type": "SB_DFFER",
  138051. "parameters": {
  138052. },
  138053. "attributes": {
  138054. "module_not_derived": "00000000000000000000000000000001",
  138055. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  138056. },
  138057. "port_directions": {
  138058. "C": "input",
  138059. "D": "input",
  138060. "E": "input",
  138061. "Q": "output",
  138062. "R": "input"
  138063. },
  138064. "connections": {
  138065. "C": [ 42 ],
  138066. "D": [ 104 ],
  138067. "E": [ 5392 ],
  138068. "Q": [ 5745 ],
  138069. "R": [ 127 ]
  138070. }
  138071. },
  138072. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  138073. "hide_name": 0,
  138074. "type": "SB_DFF",
  138075. "parameters": {
  138076. },
  138077. "attributes": {
  138078. "BEL": " ",
  138079. "SERDES_ATTR": " ",
  138080. "SERDES_GRP": "00000000000000000001000000000001",
  138081. "dont_touch": "00000000000000000000000000000001",
  138082. "hdlname": "phy_I bit[1].osd_o_I genblk1[1].dff_cap_I genblk1.dff_I",
  138083. "keep": "00000000000000000000000000000001",
  138084. "module_not_derived": "00000000000000000000000000000001",
  138085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138086. },
  138087. "port_directions": {
  138088. "C": "input",
  138089. "D": "input",
  138090. "Q": "output"
  138091. },
  138092. "connections": {
  138093. "C": [ 42 ],
  138094. "D": [ 5736 ],
  138095. "Q": [ 5746 ]
  138096. }
  138097. },
  138098. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_DFF_Q": {
  138099. "hide_name": 0,
  138100. "type": "SB_DFF",
  138101. "parameters": {
  138102. },
  138103. "attributes": {
  138104. "module_not_derived": "00000000000000000000000000000001",
  138105. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  138106. },
  138107. "port_directions": {
  138108. "C": "input",
  138109. "D": "input",
  138110. "Q": "output"
  138111. },
  138112. "connections": {
  138113. "C": [ 42 ],
  138114. "D": [ 5740 ],
  138115. "Q": [ 5747 ]
  138116. }
  138117. },
  138118. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0": {
  138119. "hide_name": 0,
  138120. "type": "SB_LUT4",
  138121. "parameters": {
  138122. "LUT_INIT": "1111111100110101"
  138123. },
  138124. "attributes": {
  138125. "module_not_derived": "00000000000000000000000000000001",
  138126. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  138127. },
  138128. "port_directions": {
  138129. "I0": "input",
  138130. "I1": "input",
  138131. "I2": "input",
  138132. "I3": "input",
  138133. "O": "output"
  138134. },
  138135. "connections": {
  138136. "I0": [ 5747 ],
  138137. "I1": [ 5602 ],
  138138. "I2": [ 5551 ],
  138139. "I3": [ 5390 ],
  138140. "O": [ 5748 ]
  138141. }
  138142. },
  138143. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1": {
  138144. "hide_name": 0,
  138145. "type": "SB_LUT4",
  138146. "parameters": {
  138147. "LUT_INIT": "1111111100111111"
  138148. },
  138149. "attributes": {
  138150. "module_not_derived": "00000000000000000000000000000001",
  138151. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138152. },
  138153. "port_directions": {
  138154. "I0": "input",
  138155. "I1": "input",
  138156. "I2": "input",
  138157. "I3": "input",
  138158. "O": "output"
  138159. },
  138160. "connections": {
  138161. "I0": [ "0" ],
  138162. "I1": [ 5748 ],
  138163. "I2": [ 5749 ],
  138164. "I3": [ 5750 ],
  138165. "O": [ 5751 ]
  138166. }
  138167. },
  138168. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  138169. "hide_name": 0,
  138170. "type": "SB_LUT4",
  138171. "parameters": {
  138172. "LUT_INIT": "0001010100111111"
  138173. },
  138174. "attributes": {
  138175. "module_not_derived": "00000000000000000000000000000001",
  138176. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  138177. },
  138178. "port_directions": {
  138179. "I0": "input",
  138180. "I1": "input",
  138181. "I2": "input",
  138182. "I3": "input",
  138183. "O": "output"
  138184. },
  138185. "connections": {
  138186. "I0": [ 250 ],
  138187. "I1": [ 5752 ],
  138188. "I2": [ 5418 ],
  138189. "I3": [ 122 ],
  138190. "O": [ 5749 ]
  138191. }
  138192. },
  138193. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  138194. "hide_name": 0,
  138195. "type": "SB_DFFER",
  138196. "parameters": {
  138197. },
  138198. "attributes": {
  138199. "module_not_derived": "00000000000000000000000000000001",
  138200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  138201. },
  138202. "port_directions": {
  138203. "C": "input",
  138204. "D": "input",
  138205. "E": "input",
  138206. "Q": "output",
  138207. "R": "input"
  138208. },
  138209. "connections": {
  138210. "C": [ 42 ],
  138211. "D": [ 106 ],
  138212. "E": [ 5392 ],
  138213. "Q": [ 5752 ],
  138214. "R": [ 127 ]
  138215. }
  138216. },
  138217. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  138218. "hide_name": 0,
  138219. "type": "SB_DFF",
  138220. "parameters": {
  138221. },
  138222. "attributes": {
  138223. "BEL": " ",
  138224. "SERDES_ATTR": " ",
  138225. "SERDES_GRP": "00000000000000000001000000000010",
  138226. "dont_touch": "00000000000000000000000000000001",
  138227. "hdlname": "phy_I bit[1].osd_o_I genblk1[2].dff_cap_I genblk1.dff_I",
  138228. "keep": "00000000000000000000000000000001",
  138229. "module_not_derived": "00000000000000000000000000000001",
  138230. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138231. },
  138232. "port_directions": {
  138233. "C": "input",
  138234. "D": "input",
  138235. "Q": "output"
  138236. },
  138237. "connections": {
  138238. "C": [ 42 ],
  138239. "D": [ 5747 ],
  138240. "Q": [ 5753 ]
  138241. }
  138242. },
  138243. "phy_I.bit[1].osd_o_I.genblk1[3].dff_cap_I.d_SB_DFF_Q": {
  138244. "hide_name": 0,
  138245. "type": "SB_DFF",
  138246. "parameters": {
  138247. },
  138248. "attributes": {
  138249. "module_not_derived": "00000000000000000000000000000001",
  138250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  138251. },
  138252. "port_directions": {
  138253. "C": "input",
  138254. "D": "input",
  138255. "Q": "output"
  138256. },
  138257. "connections": {
  138258. "C": [ 42 ],
  138259. "D": [ 5751 ],
  138260. "Q": [ 5685 ]
  138261. }
  138262. },
  138263. "phy_I.bit[1].osd_o_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  138264. "hide_name": 0,
  138265. "type": "SB_DFF",
  138266. "parameters": {
  138267. },
  138268. "attributes": {
  138269. "BEL": " ",
  138270. "SERDES_ATTR": " ",
  138271. "SERDES_GRP": "00000000000000000001000000000011",
  138272. "dont_touch": "00000000000000000000000000000001",
  138273. "hdlname": "phy_I bit[1].osd_o_I genblk1[3].dff_cap_I genblk1.dff_I",
  138274. "keep": "00000000000000000000000000000001",
  138275. "module_not_derived": "00000000000000000000000000000001",
  138276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138277. },
  138278. "port_directions": {
  138279. "C": "input",
  138280. "D": "input",
  138281. "Q": "output"
  138282. },
  138283. "connections": {
  138284. "C": [ 42 ],
  138285. "D": [ 5685 ],
  138286. "Q": [ 5754 ]
  138287. }
  138288. },
  138289. "phy_I.bit[1].osd_o_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  138290. "hide_name": 0,
  138291. "type": "SB_LUT4",
  138292. "parameters": {
  138293. "LUT_INIT": "1111000000000000"
  138294. },
  138295. "attributes": {
  138296. "module_not_derived": "00000000000000000000000000000001",
  138297. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  138298. },
  138299. "port_directions": {
  138300. "I0": "input",
  138301. "I1": "input",
  138302. "I2": "input",
  138303. "I3": "input",
  138304. "O": "output"
  138305. },
  138306. "connections": {
  138307. "I0": [ "0" ],
  138308. "I1": [ "0" ],
  138309. "I2": [ 5734 ],
  138310. "I3": [ 5672 ],
  138311. "O": [ 5755 ]
  138312. }
  138313. },
  138314. "phy_I.bit[1].osd_o_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  138315. "hide_name": 0,
  138316. "type": "SB_DFF",
  138317. "parameters": {
  138318. },
  138319. "attributes": {
  138320. "BEL": " ",
  138321. "SERDES_ATTR": " ",
  138322. "SERDES_GRP": "00000000000000000001000000010000",
  138323. "dont_touch": "00000000000000000000000000000001",
  138324. "hdlname": "phy_I bit[1].osd_o_I genblk2[0].dff_shift_I genblk1.dff_I",
  138325. "keep": "00000000000000000000000000000001",
  138326. "module_not_derived": "00000000000000000000000000000001",
  138327. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138328. },
  138329. "port_directions": {
  138330. "C": "input",
  138331. "D": "input",
  138332. "Q": "output"
  138333. },
  138334. "connections": {
  138335. "C": [ 5666 ],
  138336. "D": [ 5755 ],
  138337. "Q": [ 5756 ]
  138338. }
  138339. },
  138340. "phy_I.bit[1].osd_o_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  138341. "hide_name": 0,
  138342. "type": "SB_LUT4",
  138343. "parameters": {
  138344. "LUT_INIT": "1111000011001100"
  138345. },
  138346. "attributes": {
  138347. "module_not_derived": "00000000000000000000000000000001",
  138348. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138349. },
  138350. "port_directions": {
  138351. "I0": "input",
  138352. "I1": "input",
  138353. "I2": "input",
  138354. "I3": "input",
  138355. "O": "output"
  138356. },
  138357. "connections": {
  138358. "I0": [ "0" ],
  138359. "I1": [ 5756 ],
  138360. "I2": [ 5746 ],
  138361. "I3": [ 5672 ],
  138362. "O": [ 5757 ]
  138363. }
  138364. },
  138365. "phy_I.bit[1].osd_o_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  138366. "hide_name": 0,
  138367. "type": "SB_DFF",
  138368. "parameters": {
  138369. },
  138370. "attributes": {
  138371. "BEL": " ",
  138372. "SERDES_ATTR": " ",
  138373. "SERDES_GRP": "00000000000000000001000000010001",
  138374. "dont_touch": "00000000000000000000000000000001",
  138375. "hdlname": "phy_I bit[1].osd_o_I genblk2[1].dff_shift_I genblk1.dff_I",
  138376. "keep": "00000000000000000000000000000001",
  138377. "module_not_derived": "00000000000000000000000000000001",
  138378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138379. },
  138380. "port_directions": {
  138381. "C": "input",
  138382. "D": "input",
  138383. "Q": "output"
  138384. },
  138385. "connections": {
  138386. "C": [ 5666 ],
  138387. "D": [ 5757 ],
  138388. "Q": [ 5758 ]
  138389. }
  138390. },
  138391. "phy_I.bit[1].osd_o_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  138392. "hide_name": 0,
  138393. "type": "SB_LUT4",
  138394. "parameters": {
  138395. "LUT_INIT": "1111000011001100"
  138396. },
  138397. "attributes": {
  138398. "module_not_derived": "00000000000000000000000000000001",
  138399. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138400. },
  138401. "port_directions": {
  138402. "I0": "input",
  138403. "I1": "input",
  138404. "I2": "input",
  138405. "I3": "input",
  138406. "O": "output"
  138407. },
  138408. "connections": {
  138409. "I0": [ "0" ],
  138410. "I1": [ 5758 ],
  138411. "I2": [ 5753 ],
  138412. "I3": [ 5672 ],
  138413. "O": [ 5759 ]
  138414. }
  138415. },
  138416. "phy_I.bit[1].osd_o_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  138417. "hide_name": 0,
  138418. "type": "SB_DFF",
  138419. "parameters": {
  138420. },
  138421. "attributes": {
  138422. "BEL": " ",
  138423. "SERDES_ATTR": " ",
  138424. "SERDES_GRP": "00000000000000000001000000010010",
  138425. "dont_touch": "00000000000000000000000000000001",
  138426. "hdlname": "phy_I bit[1].osd_o_I genblk2[2].dff_shift_I genblk1.dff_I",
  138427. "keep": "00000000000000000000000000000001",
  138428. "module_not_derived": "00000000000000000000000000000001",
  138429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138430. },
  138431. "port_directions": {
  138432. "C": "input",
  138433. "D": "input",
  138434. "Q": "output"
  138435. },
  138436. "connections": {
  138437. "C": [ 5666 ],
  138438. "D": [ 5759 ],
  138439. "Q": [ 5760 ]
  138440. }
  138441. },
  138442. "phy_I.bit[1].osd_o_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  138443. "hide_name": 0,
  138444. "type": "SB_LUT4",
  138445. "parameters": {
  138446. "LUT_INIT": "1111000011001100"
  138447. },
  138448. "attributes": {
  138449. "module_not_derived": "00000000000000000000000000000001",
  138450. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138451. },
  138452. "port_directions": {
  138453. "I0": "input",
  138454. "I1": "input",
  138455. "I2": "input",
  138456. "I3": "input",
  138457. "O": "output"
  138458. },
  138459. "connections": {
  138460. "I0": [ "0" ],
  138461. "I1": [ 5760 ],
  138462. "I2": [ 5754 ],
  138463. "I3": [ 5672 ],
  138464. "O": [ 5761 ]
  138465. }
  138466. },
  138467. "phy_I.bit[1].osd_o_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  138468. "hide_name": 0,
  138469. "type": "SB_DFF",
  138470. "parameters": {
  138471. },
  138472. "attributes": {
  138473. "BEL": " ",
  138474. "SERDES_ATTR": " ",
  138475. "SERDES_GRP": "00000000000000000001000000010011",
  138476. "dont_touch": "00000000000000000000000000000001",
  138477. "hdlname": "phy_I bit[1].osd_o_I genblk2[3].dff_shift_I genblk1.dff_I",
  138478. "keep": "00000000000000000000000000000001",
  138479. "module_not_derived": "00000000000000000000000000000001",
  138480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138481. },
  138482. "port_directions": {
  138483. "C": "input",
  138484. "D": "input",
  138485. "Q": "output"
  138486. },
  138487. "connections": {
  138488. "C": [ 5666 ],
  138489. "D": [ 5761 ],
  138490. "Q": [ 5762 ]
  138491. }
  138492. },
  138493. "phy_I.bit[1].osd_oe_I.genblk1[0].dff_cap_I.d_SB_LUT4_O": {
  138494. "hide_name": 0,
  138495. "type": "SB_LUT4",
  138496. "parameters": {
  138497. "LUT_INIT": "1111000000000000"
  138498. },
  138499. "attributes": {
  138500. "module_not_derived": "00000000000000000000000000000001",
  138501. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  138502. },
  138503. "port_directions": {
  138504. "I0": "input",
  138505. "I1": "input",
  138506. "I2": "input",
  138507. "I3": "input",
  138508. "O": "output"
  138509. },
  138510. "connections": {
  138511. "I0": [ "0" ],
  138512. "I1": [ "0" ],
  138513. "I2": [ 5461 ],
  138514. "I3": [ 5551 ],
  138515. "O": [ 5612 ]
  138516. }
  138517. },
  138518. "phy_I.bit[1].osd_oe_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  138519. "hide_name": 0,
  138520. "type": "SB_DFF",
  138521. "parameters": {
  138522. },
  138523. "attributes": {
  138524. "BEL": " ",
  138525. "SERDES_ATTR": " ",
  138526. "SERDES_GRP": "00000000000000000001001000000000",
  138527. "dont_touch": "00000000000000000000000000000001",
  138528. "hdlname": "phy_I bit[1].osd_oe_I genblk1[0].dff_cap_I genblk1.dff_I",
  138529. "keep": "00000000000000000000000000000001",
  138530. "module_not_derived": "00000000000000000000000000000001",
  138531. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138532. },
  138533. "port_directions": {
  138534. "C": "input",
  138535. "D": "input",
  138536. "Q": "output"
  138537. },
  138538. "connections": {
  138539. "C": [ 42 ],
  138540. "D": [ 5612 ],
  138541. "Q": [ 5763 ]
  138542. }
  138543. },
  138544. "phy_I.bit[1].osd_oe_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  138545. "hide_name": 0,
  138546. "type": "SB_DFF",
  138547. "parameters": {
  138548. },
  138549. "attributes": {
  138550. "BEL": " ",
  138551. "SERDES_ATTR": " ",
  138552. "SERDES_GRP": "00000000000000000001001000000001",
  138553. "dont_touch": "00000000000000000000000000000001",
  138554. "hdlname": "phy_I bit[1].osd_oe_I genblk1[1].dff_cap_I genblk1.dff_I",
  138555. "keep": "00000000000000000000000000000001",
  138556. "module_not_derived": "00000000000000000000000000000001",
  138557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138558. },
  138559. "port_directions": {
  138560. "C": "input",
  138561. "D": "input",
  138562. "Q": "output"
  138563. },
  138564. "connections": {
  138565. "C": [ 42 ],
  138566. "D": [ 5612 ],
  138567. "Q": [ 5764 ]
  138568. }
  138569. },
  138570. "phy_I.bit[1].osd_oe_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  138571. "hide_name": 0,
  138572. "type": "SB_DFF",
  138573. "parameters": {
  138574. },
  138575. "attributes": {
  138576. "BEL": " ",
  138577. "SERDES_ATTR": " ",
  138578. "SERDES_GRP": "00000000000000000001001000000010",
  138579. "dont_touch": "00000000000000000000000000000001",
  138580. "hdlname": "phy_I bit[1].osd_oe_I genblk1[2].dff_cap_I genblk1.dff_I",
  138581. "keep": "00000000000000000000000000000001",
  138582. "module_not_derived": "00000000000000000000000000000001",
  138583. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138584. },
  138585. "port_directions": {
  138586. "C": "input",
  138587. "D": "input",
  138588. "Q": "output"
  138589. },
  138590. "connections": {
  138591. "C": [ 42 ],
  138592. "D": [ 5612 ],
  138593. "Q": [ 5765 ]
  138594. }
  138595. },
  138596. "phy_I.bit[1].osd_oe_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  138597. "hide_name": 0,
  138598. "type": "SB_DFF",
  138599. "parameters": {
  138600. },
  138601. "attributes": {
  138602. "BEL": " ",
  138603. "SERDES_ATTR": " ",
  138604. "SERDES_GRP": "00000000000000000001001000000011",
  138605. "dont_touch": "00000000000000000000000000000001",
  138606. "hdlname": "phy_I bit[1].osd_oe_I genblk1[3].dff_cap_I genblk1.dff_I",
  138607. "keep": "00000000000000000000000000000001",
  138608. "module_not_derived": "00000000000000000000000000000001",
  138609. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138610. },
  138611. "port_directions": {
  138612. "C": "input",
  138613. "D": "input",
  138614. "Q": "output"
  138615. },
  138616. "connections": {
  138617. "C": [ 42 ],
  138618. "D": [ 5612 ],
  138619. "Q": [ 5766 ]
  138620. }
  138621. },
  138622. "phy_I.bit[1].osd_oe_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  138623. "hide_name": 0,
  138624. "type": "SB_LUT4",
  138625. "parameters": {
  138626. "LUT_INIT": "1111000000000000"
  138627. },
  138628. "attributes": {
  138629. "module_not_derived": "00000000000000000000000000000001",
  138630. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  138631. },
  138632. "port_directions": {
  138633. "I0": "input",
  138634. "I1": "input",
  138635. "I2": "input",
  138636. "I3": "input",
  138637. "O": "output"
  138638. },
  138639. "connections": {
  138640. "I0": [ "0" ],
  138641. "I1": [ "0" ],
  138642. "I2": [ 5763 ],
  138643. "I3": [ 5672 ],
  138644. "O": [ 5767 ]
  138645. }
  138646. },
  138647. "phy_I.bit[1].osd_oe_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  138648. "hide_name": 0,
  138649. "type": "SB_DFF",
  138650. "parameters": {
  138651. },
  138652. "attributes": {
  138653. "BEL": " ",
  138654. "SERDES_ATTR": " ",
  138655. "SERDES_GRP": "00000000000000000001001000010000",
  138656. "dont_touch": "00000000000000000000000000000001",
  138657. "hdlname": "phy_I bit[1].osd_oe_I genblk2[0].dff_shift_I genblk1.dff_I",
  138658. "keep": "00000000000000000000000000000001",
  138659. "module_not_derived": "00000000000000000000000000000001",
  138660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138661. },
  138662. "port_directions": {
  138663. "C": "input",
  138664. "D": "input",
  138665. "Q": "output"
  138666. },
  138667. "connections": {
  138668. "C": [ 5666 ],
  138669. "D": [ 5767 ],
  138670. "Q": [ 5768 ]
  138671. }
  138672. },
  138673. "phy_I.bit[1].osd_oe_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  138674. "hide_name": 0,
  138675. "type": "SB_LUT4",
  138676. "parameters": {
  138677. "LUT_INIT": "1111000011001100"
  138678. },
  138679. "attributes": {
  138680. "module_not_derived": "00000000000000000000000000000001",
  138681. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138682. },
  138683. "port_directions": {
  138684. "I0": "input",
  138685. "I1": "input",
  138686. "I2": "input",
  138687. "I3": "input",
  138688. "O": "output"
  138689. },
  138690. "connections": {
  138691. "I0": [ "0" ],
  138692. "I1": [ 5768 ],
  138693. "I2": [ 5764 ],
  138694. "I3": [ 5672 ],
  138695. "O": [ 5769 ]
  138696. }
  138697. },
  138698. "phy_I.bit[1].osd_oe_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  138699. "hide_name": 0,
  138700. "type": "SB_DFF",
  138701. "parameters": {
  138702. },
  138703. "attributes": {
  138704. "BEL": " ",
  138705. "SERDES_ATTR": " ",
  138706. "SERDES_GRP": "00000000000000000001001000010001",
  138707. "dont_touch": "00000000000000000000000000000001",
  138708. "hdlname": "phy_I bit[1].osd_oe_I genblk2[1].dff_shift_I genblk1.dff_I",
  138709. "keep": "00000000000000000000000000000001",
  138710. "module_not_derived": "00000000000000000000000000000001",
  138711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138712. },
  138713. "port_directions": {
  138714. "C": "input",
  138715. "D": "input",
  138716. "Q": "output"
  138717. },
  138718. "connections": {
  138719. "C": [ 5666 ],
  138720. "D": [ 5769 ],
  138721. "Q": [ 5770 ]
  138722. }
  138723. },
  138724. "phy_I.bit[1].osd_oe_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  138725. "hide_name": 0,
  138726. "type": "SB_LUT4",
  138727. "parameters": {
  138728. "LUT_INIT": "1111000011001100"
  138729. },
  138730. "attributes": {
  138731. "module_not_derived": "00000000000000000000000000000001",
  138732. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138733. },
  138734. "port_directions": {
  138735. "I0": "input",
  138736. "I1": "input",
  138737. "I2": "input",
  138738. "I3": "input",
  138739. "O": "output"
  138740. },
  138741. "connections": {
  138742. "I0": [ "0" ],
  138743. "I1": [ 5770 ],
  138744. "I2": [ 5765 ],
  138745. "I3": [ 5672 ],
  138746. "O": [ 5771 ]
  138747. }
  138748. },
  138749. "phy_I.bit[1].osd_oe_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  138750. "hide_name": 0,
  138751. "type": "SB_DFF",
  138752. "parameters": {
  138753. },
  138754. "attributes": {
  138755. "BEL": " ",
  138756. "SERDES_ATTR": " ",
  138757. "SERDES_GRP": "00000000000000000001001000010010",
  138758. "dont_touch": "00000000000000000000000000000001",
  138759. "hdlname": "phy_I bit[1].osd_oe_I genblk2[2].dff_shift_I genblk1.dff_I",
  138760. "keep": "00000000000000000000000000000001",
  138761. "module_not_derived": "00000000000000000000000000000001",
  138762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138763. },
  138764. "port_directions": {
  138765. "C": "input",
  138766. "D": "input",
  138767. "Q": "output"
  138768. },
  138769. "connections": {
  138770. "C": [ 5666 ],
  138771. "D": [ 5771 ],
  138772. "Q": [ 5772 ]
  138773. }
  138774. },
  138775. "phy_I.bit[1].osd_oe_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  138776. "hide_name": 0,
  138777. "type": "SB_LUT4",
  138778. "parameters": {
  138779. "LUT_INIT": "1111000011001100"
  138780. },
  138781. "attributes": {
  138782. "module_not_derived": "00000000000000000000000000000001",
  138783. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  138784. },
  138785. "port_directions": {
  138786. "I0": "input",
  138787. "I1": "input",
  138788. "I2": "input",
  138789. "I3": "input",
  138790. "O": "output"
  138791. },
  138792. "connections": {
  138793. "I0": [ "0" ],
  138794. "I1": [ 5772 ],
  138795. "I2": [ 5766 ],
  138796. "I3": [ 5672 ],
  138797. "O": [ 5773 ]
  138798. }
  138799. },
  138800. "phy_I.bit[1].osd_oe_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  138801. "hide_name": 0,
  138802. "type": "SB_DFF",
  138803. "parameters": {
  138804. },
  138805. "attributes": {
  138806. "BEL": " ",
  138807. "SERDES_ATTR": " ",
  138808. "SERDES_GRP": "00000000000000000001001000010011",
  138809. "dont_touch": "00000000000000000000000000000001",
  138810. "hdlname": "phy_I bit[1].osd_oe_I genblk2[3].dff_shift_I genblk1.dff_I",
  138811. "keep": "00000000000000000000000000000001",
  138812. "module_not_derived": "00000000000000000000000000000001",
  138813. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138814. },
  138815. "port_directions": {
  138816. "C": "input",
  138817. "D": "input",
  138818. "Q": "output"
  138819. },
  138820. "connections": {
  138821. "C": [ 5666 ],
  138822. "D": [ 5773 ],
  138823. "Q": [ 5774 ]
  138824. }
  138825. },
  138826. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.genblk1.dff_I": {
  138827. "hide_name": 0,
  138828. "type": "SB_DFF",
  138829. "parameters": {
  138830. },
  138831. "attributes": {
  138832. "BEL": " ",
  138833. "SERDES_ATTR": " ",
  138834. "SERDES_GRP": "00000000000000000010010010100000",
  138835. "dont_touch": "00000000000000000000000000000001",
  138836. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[0].dff_shift_I genblk1.dff_I",
  138837. "keep": "00000000000000000000000000000001",
  138838. "module_not_derived": "00000000000000000000000000000001",
  138839. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138840. },
  138841. "port_directions": {
  138842. "C": "input",
  138843. "D": "input",
  138844. "Q": "output"
  138845. },
  138846. "connections": {
  138847. "C": [ 5666 ],
  138848. "D": [ 5775 ],
  138849. "Q": [ 5776 ]
  138850. }
  138851. },
  138852. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.genblk1.dff_I": {
  138853. "hide_name": 0,
  138854. "type": "SB_DFF",
  138855. "parameters": {
  138856. },
  138857. "attributes": {
  138858. "BEL": " ",
  138859. "SERDES_ATTR": " ",
  138860. "SERDES_GRP": "00000000000000000010010010100001",
  138861. "dont_touch": "00000000000000000000000000000001",
  138862. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[1].dff_shift_I genblk1.dff_I",
  138863. "keep": "00000000000000000000000000000001",
  138864. "module_not_derived": "00000000000000000000000000000001",
  138865. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138866. },
  138867. "port_directions": {
  138868. "C": "input",
  138869. "D": "input",
  138870. "Q": "output"
  138871. },
  138872. "connections": {
  138873. "C": [ 5666 ],
  138874. "D": [ 5776 ],
  138875. "Q": [ 5777 ]
  138876. }
  138877. },
  138878. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.genblk1.dff_I": {
  138879. "hide_name": 0,
  138880. "type": "SB_DFF",
  138881. "parameters": {
  138882. },
  138883. "attributes": {
  138884. "BEL": " ",
  138885. "SERDES_ATTR": " ",
  138886. "SERDES_GRP": "00000000000000000010010010100010",
  138887. "dont_touch": "00000000000000000000000000000001",
  138888. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[2].dff_shift_I genblk1.dff_I",
  138889. "keep": "00000000000000000000000000000001",
  138890. "module_not_derived": "00000000000000000000000000000001",
  138891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138892. },
  138893. "port_directions": {
  138894. "C": "input",
  138895. "D": "input",
  138896. "Q": "output"
  138897. },
  138898. "connections": {
  138899. "C": [ 5666 ],
  138900. "D": [ 5777 ],
  138901. "Q": [ 5778 ]
  138902. }
  138903. },
  138904. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.genblk1.dff_I": {
  138905. "hide_name": 0,
  138906. "type": "SB_DFF",
  138907. "parameters": {
  138908. },
  138909. "attributes": {
  138910. "BEL": " ",
  138911. "SERDES_ATTR": " ",
  138912. "SERDES_GRP": "00000000000000000010010010100011",
  138913. "dont_touch": "00000000000000000000000000000001",
  138914. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[3].dff_shift_I genblk1.dff_I",
  138915. "keep": "00000000000000000000000000000001",
  138916. "module_not_derived": "00000000000000000000000000000001",
  138917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  138918. },
  138919. "port_directions": {
  138920. "C": "input",
  138921. "D": "input",
  138922. "Q": "output"
  138923. },
  138924. "connections": {
  138925. "C": [ 5666 ],
  138926. "D": [ 5778 ],
  138927. "Q": [ 5779 ]
  138928. }
  138929. },
  138930. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  138931. "hide_name": 0,
  138932. "type": "SB_DFFE",
  138933. "parameters": {
  138934. },
  138935. "attributes": {
  138936. "BEL": " ",
  138937. "SERDES_ATTR": " ",
  138938. "SERDES_GRP": "00000000000000000010010010010000",
  138939. "dont_touch": "00000000000000000000000000000001",
  138940. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[0].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  138941. "keep": "00000000000000000000000000000001",
  138942. "module_not_derived": "00000000000000000000000000000001",
  138943. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  138944. },
  138945. "port_directions": {
  138946. "C": "input",
  138947. "D": "input",
  138948. "E": "input",
  138949. "Q": "output"
  138950. },
  138951. "connections": {
  138952. "C": [ 5666 ],
  138953. "D": [ 5776 ],
  138954. "E": [ 5672 ],
  138955. "Q": [ 5780 ]
  138956. }
  138957. },
  138958. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  138959. "hide_name": 0,
  138960. "type": "SB_DFFE",
  138961. "parameters": {
  138962. },
  138963. "attributes": {
  138964. "BEL": " ",
  138965. "SERDES_ATTR": " ",
  138966. "SERDES_GRP": "00000000000000000010010010010001",
  138967. "dont_touch": "00000000000000000000000000000001",
  138968. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[1].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  138969. "keep": "00000000000000000000000000000001",
  138970. "module_not_derived": "00000000000000000000000000000001",
  138971. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  138972. },
  138973. "port_directions": {
  138974. "C": "input",
  138975. "D": "input",
  138976. "E": "input",
  138977. "Q": "output"
  138978. },
  138979. "connections": {
  138980. "C": [ 5666 ],
  138981. "D": [ 5777 ],
  138982. "E": [ 5672 ],
  138983. "Q": [ 5781 ]
  138984. }
  138985. },
  138986. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  138987. "hide_name": 0,
  138988. "type": "SB_DFFE",
  138989. "parameters": {
  138990. },
  138991. "attributes": {
  138992. "BEL": " ",
  138993. "SERDES_ATTR": " ",
  138994. "SERDES_GRP": "00000000000000000010010010010010",
  138995. "dont_touch": "00000000000000000000000000000001",
  138996. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[2].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  138997. "keep": "00000000000000000000000000000001",
  138998. "module_not_derived": "00000000000000000000000000000001",
  138999. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  139000. },
  139001. "port_directions": {
  139002. "C": "input",
  139003. "D": "input",
  139004. "E": "input",
  139005. "Q": "output"
  139006. },
  139007. "connections": {
  139008. "C": [ 5666 ],
  139009. "D": [ 5778 ],
  139010. "E": [ 5672 ],
  139011. "Q": [ 5782 ]
  139012. }
  139013. },
  139014. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  139015. "hide_name": 0,
  139016. "type": "SB_DFFE",
  139017. "parameters": {
  139018. },
  139019. "attributes": {
  139020. "BEL": " ",
  139021. "SERDES_ATTR": " ",
  139022. "SERDES_GRP": "00000000000000000010010010010011",
  139023. "dont_touch": "00000000000000000000000000000001",
  139024. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[3].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  139025. "keep": "00000000000000000000000000000001",
  139026. "module_not_derived": "00000000000000000000000000000001",
  139027. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  139028. },
  139029. "port_directions": {
  139030. "C": "input",
  139031. "D": "input",
  139032. "E": "input",
  139033. "Q": "output"
  139034. },
  139035. "connections": {
  139036. "C": [ 5666 ],
  139037. "D": [ 5779 ],
  139038. "E": [ 5672 ],
  139039. "Q": [ 5783 ]
  139040. }
  139041. },
  139042. "phy_I.bit[2].isd_I.genblk2.genblk2[0].dff_scap_I.genblk1.dff_I": {
  139043. "hide_name": 0,
  139044. "type": "SB_DFF",
  139045. "parameters": {
  139046. },
  139047. "attributes": {
  139048. "BEL": " ",
  139049. "SERDES_ATTR": " ",
  139050. "SERDES_GRP": "00000000000000000010011010000000",
  139051. "dont_touch": "00000000000000000000000000000001",
  139052. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[0].dff_scap_I genblk1.dff_I",
  139053. "keep": "00000000000000000000000000000001",
  139054. "module_not_derived": "00000000000000000000000000000001",
  139055. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139056. },
  139057. "port_directions": {
  139058. "C": "input",
  139059. "D": "input",
  139060. "Q": "output"
  139061. },
  139062. "connections": {
  139063. "C": [ 42 ],
  139064. "D": [ 5780 ],
  139065. "Q": [ 5784 ]
  139066. }
  139067. },
  139068. "phy_I.bit[2].isd_I.genblk2.genblk2[1].dff_scap_I.genblk1.dff_I": {
  139069. "hide_name": 0,
  139070. "type": "SB_DFF",
  139071. "parameters": {
  139072. },
  139073. "attributes": {
  139074. "BEL": " ",
  139075. "SERDES_ATTR": " ",
  139076. "SERDES_GRP": "00000000000000000010011010000001",
  139077. "dont_touch": "00000000000000000000000000000001",
  139078. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[1].dff_scap_I genblk1.dff_I",
  139079. "keep": "00000000000000000000000000000001",
  139080. "module_not_derived": "00000000000000000000000000000001",
  139081. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139082. },
  139083. "port_directions": {
  139084. "C": "input",
  139085. "D": "input",
  139086. "Q": "output"
  139087. },
  139088. "connections": {
  139089. "C": [ 42 ],
  139090. "D": [ 5781 ],
  139091. "Q": [ 5785 ]
  139092. }
  139093. },
  139094. "phy_I.bit[2].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I1": {
  139095. "hide_name": 0,
  139096. "type": "SB_LUT4",
  139097. "parameters": {
  139098. "LUT_INIT": "1100110011110000"
  139099. },
  139100. "attributes": {
  139101. "module_not_derived": "00000000000000000000000000000001",
  139102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  139103. },
  139104. "port_directions": {
  139105. "I0": "input",
  139106. "I1": "input",
  139107. "I2": "input",
  139108. "I3": "input",
  139109. "O": "output"
  139110. },
  139111. "connections": {
  139112. "I0": [ "0" ],
  139113. "I1": [ 5785 ],
  139114. "I2": [ 5726 ],
  139115. "I3": [ 5409 ],
  139116. "O": [ 5538 ]
  139117. }
  139118. },
  139119. "phy_I.bit[2].isd_I.genblk2.genblk2[2].dff_scap_I.genblk1.dff_I": {
  139120. "hide_name": 0,
  139121. "type": "SB_DFF",
  139122. "parameters": {
  139123. },
  139124. "attributes": {
  139125. "BEL": " ",
  139126. "SERDES_ATTR": " ",
  139127. "SERDES_GRP": "00000000000000000010011010000010",
  139128. "dont_touch": "00000000000000000000000000000001",
  139129. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[2].dff_scap_I genblk1.dff_I",
  139130. "keep": "00000000000000000000000000000001",
  139131. "module_not_derived": "00000000000000000000000000000001",
  139132. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139133. },
  139134. "port_directions": {
  139135. "C": "input",
  139136. "D": "input",
  139137. "Q": "output"
  139138. },
  139139. "connections": {
  139140. "C": [ 42 ],
  139141. "D": [ 5782 ],
  139142. "Q": [ 5786 ]
  139143. }
  139144. },
  139145. "phy_I.bit[2].isd_I.genblk2.genblk2[2].dff_scap_I.q_SB_LUT4_I2": {
  139146. "hide_name": 0,
  139147. "type": "SB_LUT4",
  139148. "parameters": {
  139149. "LUT_INIT": "1111000011001100"
  139150. },
  139151. "attributes": {
  139152. "module_not_derived": "00000000000000000000000000000001",
  139153. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  139154. },
  139155. "port_directions": {
  139156. "I0": "input",
  139157. "I1": "input",
  139158. "I2": "input",
  139159. "I3": "input",
  139160. "O": "output"
  139161. },
  139162. "connections": {
  139163. "I0": [ "0" ],
  139164. "I1": [ 216 ],
  139165. "I2": [ 5786 ],
  139166. "I3": [ 5409 ],
  139167. "O": [ 5534 ]
  139168. }
  139169. },
  139170. "phy_I.bit[2].isd_I.genblk2.genblk2[3].dff_scap_I.genblk1.dff_I": {
  139171. "hide_name": 0,
  139172. "type": "SB_DFF",
  139173. "parameters": {
  139174. },
  139175. "attributes": {
  139176. "BEL": " ",
  139177. "SERDES_ATTR": " ",
  139178. "SERDES_GRP": "00000000000000000010011010000011",
  139179. "dont_touch": "00000000000000000000000000000001",
  139180. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[3].dff_scap_I genblk1.dff_I",
  139181. "keep": "00000000000000000000000000000001",
  139182. "module_not_derived": "00000000000000000000000000000001",
  139183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139184. },
  139185. "port_directions": {
  139186. "C": "input",
  139187. "D": "input",
  139188. "Q": "output"
  139189. },
  139190. "connections": {
  139191. "C": [ 42 ],
  139192. "D": [ 5783 ],
  139193. "Q": [ 5787 ]
  139194. }
  139195. },
  139196. "phy_I.bit[2].isd_I.genblk2.genblk2[3].dff_scap_I.q_SB_LUT4_I2": {
  139197. "hide_name": 0,
  139198. "type": "SB_LUT4",
  139199. "parameters": {
  139200. "LUT_INIT": "1111000011001100"
  139201. },
  139202. "attributes": {
  139203. "module_not_derived": "00000000000000000000000000000001",
  139204. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  139205. },
  139206. "port_directions": {
  139207. "I0": "input",
  139208. "I1": "input",
  139209. "I2": "input",
  139210. "I3": "input",
  139211. "O": "output"
  139212. },
  139213. "connections": {
  139214. "I0": [ "0" ],
  139215. "I1": [ 271 ],
  139216. "I2": [ 5787 ],
  139217. "I3": [ 5409 ],
  139218. "O": [ 5530 ]
  139219. }
  139220. },
  139221. "phy_I.bit[2].isd_I.genblk2.genblk2[4].dff_scap_I.genblk1.dff_I": {
  139222. "hide_name": 0,
  139223. "type": "SB_DFF",
  139224. "parameters": {
  139225. },
  139226. "attributes": {
  139227. "BEL": " ",
  139228. "SERDES_ATTR": " ",
  139229. "SERDES_GRP": "00000000000000000010011010000100",
  139230. "dont_touch": "00000000000000000000000000000001",
  139231. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[4].dff_scap_I genblk1.dff_I",
  139232. "keep": "00000000000000000000000000000001",
  139233. "module_not_derived": "00000000000000000000000000000001",
  139234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139235. },
  139236. "port_directions": {
  139237. "C": "input",
  139238. "D": "input",
  139239. "Q": "output"
  139240. },
  139241. "connections": {
  139242. "C": [ 42 ],
  139243. "D": [ 5784 ],
  139244. "Q": [ 5788 ]
  139245. }
  139246. },
  139247. "phy_I.bit[2].isd_I.genblk2.genblk2[4].dff_scap_I.q_SB_LUT4_I2": {
  139248. "hide_name": 0,
  139249. "type": "SB_LUT4",
  139250. "parameters": {
  139251. "LUT_INIT": "1111000011001100"
  139252. },
  139253. "attributes": {
  139254. "module_not_derived": "00000000000000000000000000000001",
  139255. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  139256. },
  139257. "port_directions": {
  139258. "I0": "input",
  139259. "I1": "input",
  139260. "I2": "input",
  139261. "I3": "input",
  139262. "O": "output"
  139263. },
  139264. "connections": {
  139265. "I0": [ "0" ],
  139266. "I1": [ 220 ],
  139267. "I2": [ 5788 ],
  139268. "I3": [ 5409 ],
  139269. "O": [ 5525 ]
  139270. }
  139271. },
  139272. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_DFF_Q": {
  139273. "hide_name": 0,
  139274. "type": "SB_DFF",
  139275. "parameters": {
  139276. },
  139277. "attributes": {
  139278. "module_not_derived": "00000000000000000000000000000001",
  139279. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  139280. },
  139281. "port_directions": {
  139282. "C": "input",
  139283. "D": "input",
  139284. "Q": "output"
  139285. },
  139286. "connections": {
  139287. "C": [ 42 ],
  139288. "D": [ 5789 ],
  139289. "Q": [ 5790 ]
  139290. }
  139291. },
  139292. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1": {
  139293. "hide_name": 0,
  139294. "type": "SB_LUT4",
  139295. "parameters": {
  139296. "LUT_INIT": "0001010100111111"
  139297. },
  139298. "attributes": {
  139299. "module_not_derived": "00000000000000000000000000000001",
  139300. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139301. },
  139302. "port_directions": {
  139303. "I0": "input",
  139304. "I1": "input",
  139305. "I2": "input",
  139306. "I3": "input",
  139307. "O": "output"
  139308. },
  139309. "connections": {
  139310. "I0": [ 255 ],
  139311. "I1": [ 5790 ],
  139312. "I2": [ 5622 ],
  139313. "I3": [ 122 ],
  139314. "O": [ 5791 ]
  139315. }
  139316. },
  139317. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O": {
  139318. "hide_name": 0,
  139319. "type": "SB_LUT4",
  139320. "parameters": {
  139321. "LUT_INIT": "0001001101011111"
  139322. },
  139323. "attributes": {
  139324. "module_not_derived": "00000000000000000000000000000001",
  139325. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139326. },
  139327. "port_directions": {
  139328. "I0": "input",
  139329. "I1": "input",
  139330. "I2": "input",
  139331. "I3": "input",
  139332. "O": "output"
  139333. },
  139334. "connections": {
  139335. "I0": [ 5580 ],
  139336. "I1": [ 5792 ],
  139337. "I2": [ 5613 ],
  139338. "I3": [ 5418 ],
  139339. "O": [ 5793 ]
  139340. }
  139341. },
  139342. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_1": {
  139343. "hide_name": 0,
  139344. "type": "SB_LUT4",
  139345. "parameters": {
  139346. "LUT_INIT": "1100101000000000"
  139347. },
  139348. "attributes": {
  139349. "module_not_derived": "00000000000000000000000000000001",
  139350. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139351. },
  139352. "port_directions": {
  139353. "I0": "input",
  139354. "I1": "input",
  139355. "I2": "input",
  139356. "I3": "input",
  139357. "O": "output"
  139358. },
  139359. "connections": {
  139360. "I0": [ 483 ],
  139361. "I1": [ 367 ],
  139362. "I2": [ 647 ],
  139363. "I3": [ 5419 ],
  139364. "O": [ 5794 ]
  139365. }
  139366. },
  139367. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  139368. "hide_name": 0,
  139369. "type": "SB_DFFER",
  139370. "parameters": {
  139371. },
  139372. "attributes": {
  139373. "module_not_derived": "00000000000000000000000000000001",
  139374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  139375. },
  139376. "port_directions": {
  139377. "C": "input",
  139378. "D": "input",
  139379. "E": "input",
  139380. "Q": "output",
  139381. "R": "input"
  139382. },
  139383. "connections": {
  139384. "C": [ 42 ],
  139385. "D": [ 101 ],
  139386. "E": [ 5392 ],
  139387. "Q": [ 5792 ],
  139388. "R": [ 127 ]
  139389. }
  139390. },
  139391. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_I2_SB_DFFER_Q": {
  139392. "hide_name": 0,
  139393. "type": "SB_DFFER",
  139394. "parameters": {
  139395. },
  139396. "attributes": {
  139397. "module_not_derived": "00000000000000000000000000000001",
  139398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  139399. },
  139400. "port_directions": {
  139401. "C": "input",
  139402. "D": "input",
  139403. "E": "input",
  139404. "Q": "output",
  139405. "R": "input"
  139406. },
  139407. "connections": {
  139408. "C": [ 42 ],
  139409. "D": [ 97 ],
  139410. "E": [ 5392 ],
  139411. "Q": [ 5795 ],
  139412. "R": [ 127 ]
  139413. }
  139414. },
  139415. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  139416. "hide_name": 0,
  139417. "type": "SB_DFF",
  139418. "parameters": {
  139419. },
  139420. "attributes": {
  139421. "BEL": " ",
  139422. "SERDES_ATTR": " ",
  139423. "SERDES_GRP": "00000000000000000010000000000000",
  139424. "dont_touch": "00000000000000000000000000000001",
  139425. "hdlname": "phy_I bit[2].osd_o_I genblk1[0].dff_cap_I genblk1.dff_I",
  139426. "keep": "00000000000000000000000000000001",
  139427. "module_not_derived": "00000000000000000000000000000001",
  139428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139429. },
  139430. "port_directions": {
  139431. "C": "input",
  139432. "D": "input",
  139433. "Q": "output"
  139434. },
  139435. "connections": {
  139436. "C": [ 42 ],
  139437. "D": [ 5790 ],
  139438. "Q": [ 5796 ]
  139439. }
  139440. },
  139441. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.d_SB_DFF_Q": {
  139442. "hide_name": 0,
  139443. "type": "SB_DFF",
  139444. "parameters": {
  139445. },
  139446. "attributes": {
  139447. "module_not_derived": "00000000000000000000000000000001",
  139448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  139449. },
  139450. "port_directions": {
  139451. "C": "input",
  139452. "D": "input",
  139453. "Q": "output"
  139454. },
  139455. "connections": {
  139456. "C": [ 42 ],
  139457. "D": [ 5797 ],
  139458. "Q": [ 5798 ]
  139459. }
  139460. },
  139461. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0": {
  139462. "hide_name": 0,
  139463. "type": "SB_LUT4",
  139464. "parameters": {
  139465. "LUT_INIT": "0001001101011111"
  139466. },
  139467. "attributes": {
  139468. "module_not_derived": "00000000000000000000000000000001",
  139469. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139470. },
  139471. "port_directions": {
  139472. "I0": "input",
  139473. "I1": "input",
  139474. "I2": "input",
  139475. "I3": "input",
  139476. "O": "output"
  139477. },
  139478. "connections": {
  139479. "I0": [ 5798 ],
  139480. "I1": [ 182 ],
  139481. "I2": [ 5622 ],
  139482. "I3": [ 122 ],
  139483. "O": [ 5799 ]
  139484. }
  139485. },
  139486. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_DFFER_Q": {
  139487. "hide_name": 0,
  139488. "type": "SB_DFFER",
  139489. "parameters": {
  139490. },
  139491. "attributes": {
  139492. "module_not_derived": "00000000000000000000000000000001",
  139493. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  139494. },
  139495. "port_directions": {
  139496. "C": "input",
  139497. "D": "input",
  139498. "E": "input",
  139499. "Q": "output",
  139500. "R": "input"
  139501. },
  139502. "connections": {
  139503. "C": [ 42 ],
  139504. "D": [ 100 ],
  139505. "E": [ 5392 ],
  139506. "Q": [ 5800 ],
  139507. "R": [ 127 ]
  139508. }
  139509. },
  139510. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  139511. "hide_name": 0,
  139512. "type": "SB_LUT4",
  139513. "parameters": {
  139514. "LUT_INIT": "1111000000000000"
  139515. },
  139516. "attributes": {
  139517. "module_not_derived": "00000000000000000000000000000001",
  139518. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  139519. },
  139520. "port_directions": {
  139521. "I0": "input",
  139522. "I1": "input",
  139523. "I2": "input",
  139524. "I3": "input",
  139525. "O": "output"
  139526. },
  139527. "connections": {
  139528. "I0": [ "0" ],
  139529. "I1": [ "0" ],
  139530. "I2": [ 5608 ],
  139531. "I3": [ 5613 ],
  139532. "O": [ 5801 ]
  139533. }
  139534. },
  139535. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  139536. "hide_name": 0,
  139537. "type": "SB_DFF",
  139538. "parameters": {
  139539. },
  139540. "attributes": {
  139541. "BEL": " ",
  139542. "SERDES_ATTR": " ",
  139543. "SERDES_GRP": "00000000000000000010000000000001",
  139544. "dont_touch": "00000000000000000000000000000001",
  139545. "hdlname": "phy_I bit[2].osd_o_I genblk1[1].dff_cap_I genblk1.dff_I",
  139546. "keep": "00000000000000000000000000000001",
  139547. "module_not_derived": "00000000000000000000000000000001",
  139548. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  139549. },
  139550. "port_directions": {
  139551. "C": "input",
  139552. "D": "input",
  139553. "Q": "output"
  139554. },
  139555. "connections": {
  139556. "C": [ 42 ],
  139557. "D": [ 5798 ],
  139558. "Q": [ 5802 ]
  139559. }
  139560. },
  139561. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_DFF_Q": {
  139562. "hide_name": 0,
  139563. "type": "SB_DFF",
  139564. "parameters": {
  139565. },
  139566. "attributes": {
  139567. "module_not_derived": "00000000000000000000000000000001",
  139568. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  139569. },
  139570. "port_directions": {
  139571. "C": "input",
  139572. "D": "input",
  139573. "Q": "output"
  139574. },
  139575. "connections": {
  139576. "C": [ 42 ],
  139577. "D": [ 5803 ],
  139578. "Q": [ 5804 ]
  139579. }
  139580. },
  139581. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0": {
  139582. "hide_name": 0,
  139583. "type": "SB_LUT4",
  139584. "parameters": {
  139585. "LUT_INIT": "1111111100110101"
  139586. },
  139587. "attributes": {
  139588. "module_not_derived": "00000000000000000000000000000001",
  139589. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139590. },
  139591. "port_directions": {
  139592. "I0": "input",
  139593. "I1": "input",
  139594. "I2": "input",
  139595. "I3": "input",
  139596. "O": "output"
  139597. },
  139598. "connections": {
  139599. "I0": [ 5804 ],
  139600. "I1": [ 5600 ],
  139601. "I2": [ 5551 ],
  139602. "I3": [ 5390 ],
  139603. "O": [ 5805 ]
  139604. }
  139605. },
  139606. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1": {
  139607. "hide_name": 0,
  139608. "type": "SB_LUT4",
  139609. "parameters": {
  139610. "LUT_INIT": "1111111100111111"
  139611. },
  139612. "attributes": {
  139613. "module_not_derived": "00000000000000000000000000000001",
  139614. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  139615. },
  139616. "port_directions": {
  139617. "I0": "input",
  139618. "I1": "input",
  139619. "I2": "input",
  139620. "I3": "input",
  139621. "O": "output"
  139622. },
  139623. "connections": {
  139624. "I0": [ "0" ],
  139625. "I1": [ 5805 ],
  139626. "I2": [ 5806 ],
  139627. "I3": [ 5750 ],
  139628. "O": [ 5807 ]
  139629. }
  139630. },
  139631. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O": {
  139632. "hide_name": 0,
  139633. "type": "SB_LUT4",
  139634. "parameters": {
  139635. "LUT_INIT": "1110101011000000"
  139636. },
  139637. "attributes": {
  139638. "module_not_derived": "00000000000000000000000000000001",
  139639. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139640. },
  139641. "port_directions": {
  139642. "I0": "input",
  139643. "I1": "input",
  139644. "I2": "input",
  139645. "I3": "input",
  139646. "O": "output"
  139647. },
  139648. "connections": {
  139649. "I0": [ 193 ],
  139650. "I1": [ 5421 ],
  139651. "I2": [ 5418 ],
  139652. "I3": [ 122 ],
  139653. "O": [ 5589 ]
  139654. }
  139655. },
  139656. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_1": {
  139657. "hide_name": 0,
  139658. "type": "SB_LUT4",
  139659. "parameters": {
  139660. "LUT_INIT": "1110101011000000"
  139661. },
  139662. "attributes": {
  139663. "module_not_derived": "00000000000000000000000000000001",
  139664. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139665. },
  139666. "port_directions": {
  139667. "I0": "input",
  139668. "I1": "input",
  139669. "I2": "input",
  139670. "I3": "input",
  139671. "O": "output"
  139672. },
  139673. "connections": {
  139674. "I0": [ 194 ],
  139675. "I1": [ 5808 ],
  139676. "I2": [ 5418 ],
  139677. "I3": [ 122 ],
  139678. "O": [ 5587 ]
  139679. }
  139680. },
  139681. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_10": {
  139682. "hide_name": 0,
  139683. "type": "SB_LUT4",
  139684. "parameters": {
  139685. "LUT_INIT": "1111100011111111"
  139686. },
  139687. "attributes": {
  139688. "module_not_derived": "00000000000000000000000000000001",
  139689. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139690. },
  139691. "port_directions": {
  139692. "I0": "input",
  139693. "I1": "input",
  139694. "I2": "input",
  139695. "I3": "input",
  139696. "O": "output"
  139697. },
  139698. "connections": {
  139699. "I0": [ 5809 ],
  139700. "I1": [ 5418 ],
  139701. "I2": [ 5810 ],
  139702. "I3": [ 5811 ],
  139703. "O": [ 5605 ]
  139704. }
  139705. },
  139706. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_10_I0_SB_DFFER_Q": {
  139707. "hide_name": 0,
  139708. "type": "SB_DFFER",
  139709. "parameters": {
  139710. },
  139711. "attributes": {
  139712. "module_not_derived": "00000000000000000000000000000001",
  139713. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  139714. },
  139715. "port_directions": {
  139716. "C": "input",
  139717. "D": "input",
  139718. "E": "input",
  139719. "Q": "output",
  139720. "R": "input"
  139721. },
  139722. "connections": {
  139723. "C": [ 42 ],
  139724. "D": [ 73 ],
  139725. "E": [ 5392 ],
  139726. "Q": [ 5809 ],
  139727. "R": [ 127 ]
  139728. }
  139729. },
  139730. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_10_I0_SB_LUT4_O": {
  139731. "hide_name": 0,
  139732. "type": "SB_LUT4",
  139733. "parameters": {
  139734. "LUT_INIT": "0001001101011111"
  139735. },
  139736. "attributes": {
  139737. "module_not_derived": "00000000000000000000000000000001",
  139738. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139739. },
  139740. "port_directions": {
  139741. "I0": "input",
  139742. "I1": "input",
  139743. "I2": "input",
  139744. "I3": "input",
  139745. "O": "output"
  139746. },
  139747. "connections": {
  139748. "I0": [ 158 ],
  139749. "I1": [ 5578 ],
  139750. "I2": [ 5419 ],
  139751. "I3": [ 5622 ],
  139752. "O": [ 5811 ]
  139753. }
  139754. },
  139755. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_10_I0_SB_LUT4_O_1": {
  139756. "hide_name": 0,
  139757. "type": "SB_LUT4",
  139758. "parameters": {
  139759. "LUT_INIT": "1111000000000000"
  139760. },
  139761. "attributes": {
  139762. "module_not_derived": "00000000000000000000000000000001",
  139763. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  139764. },
  139765. "port_directions": {
  139766. "I0": "input",
  139767. "I1": "input",
  139768. "I2": "input",
  139769. "I3": "input",
  139770. "O": "output"
  139771. },
  139772. "connections": {
  139773. "I0": [ "0" ],
  139774. "I1": [ "0" ],
  139775. "I2": [ 191 ],
  139776. "I3": [ 122 ],
  139777. "O": [ 5810 ]
  139778. }
  139779. },
  139780. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_11": {
  139781. "hide_name": 0,
  139782. "type": "SB_LUT4",
  139783. "parameters": {
  139784. "LUT_INIT": "1111100011111111"
  139785. },
  139786. "attributes": {
  139787. "module_not_derived": "00000000000000000000000000000001",
  139788. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139789. },
  139790. "port_directions": {
  139791. "I0": "input",
  139792. "I1": "input",
  139793. "I2": "input",
  139794. "I3": "input",
  139795. "O": "output"
  139796. },
  139797. "connections": {
  139798. "I0": [ 5812 ],
  139799. "I1": [ 5418 ],
  139800. "I2": [ 5813 ],
  139801. "I3": [ 5814 ],
  139802. "O": [ 5603 ]
  139803. }
  139804. },
  139805. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_11_I0_SB_DFFER_Q": {
  139806. "hide_name": 0,
  139807. "type": "SB_DFFER",
  139808. "parameters": {
  139809. },
  139810. "attributes": {
  139811. "module_not_derived": "00000000000000000000000000000001",
  139812. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  139813. },
  139814. "port_directions": {
  139815. "C": "input",
  139816. "D": "input",
  139817. "E": "input",
  139818. "Q": "output",
  139819. "R": "input"
  139820. },
  139821. "connections": {
  139822. "C": [ 42 ],
  139823. "D": [ 63 ],
  139824. "E": [ 5392 ],
  139825. "Q": [ 5812 ],
  139826. "R": [ 127 ]
  139827. }
  139828. },
  139829. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_11_I0_SB_LUT4_O": {
  139830. "hide_name": 0,
  139831. "type": "SB_LUT4",
  139832. "parameters": {
  139833. "LUT_INIT": "0001001101011111"
  139834. },
  139835. "attributes": {
  139836. "module_not_derived": "00000000000000000000000000000001",
  139837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139838. },
  139839. "port_directions": {
  139840. "I0": "input",
  139841. "I1": "input",
  139842. "I2": "input",
  139843. "I3": "input",
  139844. "O": "output"
  139845. },
  139846. "connections": {
  139847. "I0": [ 159 ],
  139848. "I1": [ 5576 ],
  139849. "I2": [ 5419 ],
  139850. "I3": [ 5622 ],
  139851. "O": [ 5814 ]
  139852. }
  139853. },
  139854. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_11_I0_SB_LUT4_O_1": {
  139855. "hide_name": 0,
  139856. "type": "SB_LUT4",
  139857. "parameters": {
  139858. "LUT_INIT": "1111000000000000"
  139859. },
  139860. "attributes": {
  139861. "module_not_derived": "00000000000000000000000000000001",
  139862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  139863. },
  139864. "port_directions": {
  139865. "I0": "input",
  139866. "I1": "input",
  139867. "I2": "input",
  139868. "I3": "input",
  139869. "O": "output"
  139870. },
  139871. "connections": {
  139872. "I0": [ "0" ],
  139873. "I1": [ "0" ],
  139874. "I2": [ 257 ],
  139875. "I3": [ 122 ],
  139876. "O": [ 5813 ]
  139877. }
  139878. },
  139879. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_12": {
  139880. "hide_name": 0,
  139881. "type": "SB_LUT4",
  139882. "parameters": {
  139883. "LUT_INIT": "1111100011111111"
  139884. },
  139885. "attributes": {
  139886. "module_not_derived": "00000000000000000000000000000001",
  139887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139888. },
  139889. "port_directions": {
  139890. "I0": "input",
  139891. "I1": "input",
  139892. "I2": "input",
  139893. "I3": "input",
  139894. "O": "output"
  139895. },
  139896. "connections": {
  139897. "I0": [ 5815 ],
  139898. "I1": [ 5418 ],
  139899. "I2": [ 5816 ],
  139900. "I3": [ 5817 ],
  139901. "O": [ 5601 ]
  139902. }
  139903. },
  139904. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_12_I0_SB_DFFER_Q": {
  139905. "hide_name": 0,
  139906. "type": "SB_DFFER",
  139907. "parameters": {
  139908. },
  139909. "attributes": {
  139910. "module_not_derived": "00000000000000000000000000000001",
  139911. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  139912. },
  139913. "port_directions": {
  139914. "C": "input",
  139915. "D": "input",
  139916. "E": "input",
  139917. "Q": "output",
  139918. "R": "input"
  139919. },
  139920. "connections": {
  139921. "C": [ 42 ],
  139922. "D": [ 71 ],
  139923. "E": [ 5392 ],
  139924. "Q": [ 5815 ],
  139925. "R": [ 127 ]
  139926. }
  139927. },
  139928. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_12_I0_SB_LUT4_O": {
  139929. "hide_name": 0,
  139930. "type": "SB_LUT4",
  139931. "parameters": {
  139932. "LUT_INIT": "0001001101011111"
  139933. },
  139934. "attributes": {
  139935. "module_not_derived": "00000000000000000000000000000001",
  139936. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139937. },
  139938. "port_directions": {
  139939. "I0": "input",
  139940. "I1": "input",
  139941. "I2": "input",
  139942. "I3": "input",
  139943. "O": "output"
  139944. },
  139945. "connections": {
  139946. "I0": [ 160 ],
  139947. "I1": [ 5574 ],
  139948. "I2": [ 5419 ],
  139949. "I3": [ 5622 ],
  139950. "O": [ 5817 ]
  139951. }
  139952. },
  139953. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_12_I0_SB_LUT4_O_1": {
  139954. "hide_name": 0,
  139955. "type": "SB_LUT4",
  139956. "parameters": {
  139957. "LUT_INIT": "1111000000000000"
  139958. },
  139959. "attributes": {
  139960. "module_not_derived": "00000000000000000000000000000001",
  139961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  139962. },
  139963. "port_directions": {
  139964. "I0": "input",
  139965. "I1": "input",
  139966. "I2": "input",
  139967. "I3": "input",
  139968. "O": "output"
  139969. },
  139970. "connections": {
  139971. "I0": [ "0" ],
  139972. "I1": [ "0" ],
  139973. "I2": [ 258 ],
  139974. "I3": [ 122 ],
  139975. "O": [ 5816 ]
  139976. }
  139977. },
  139978. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_13": {
  139979. "hide_name": 0,
  139980. "type": "SB_LUT4",
  139981. "parameters": {
  139982. "LUT_INIT": "1111100011111111"
  139983. },
  139984. "attributes": {
  139985. "module_not_derived": "00000000000000000000000000000001",
  139986. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  139987. },
  139988. "port_directions": {
  139989. "I0": "input",
  139990. "I1": "input",
  139991. "I2": "input",
  139992. "I3": "input",
  139993. "O": "output"
  139994. },
  139995. "connections": {
  139996. "I0": [ 259 ],
  139997. "I1": [ 122 ],
  139998. "I2": [ 5818 ],
  139999. "I3": [ 5819 ],
  140000. "O": [ 5599 ]
  140001. }
  140002. },
  140003. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_13_I2_SB_LUT4_O": {
  140004. "hide_name": 0,
  140005. "type": "SB_LUT4",
  140006. "parameters": {
  140007. "LUT_INIT": "0001001101011111"
  140008. },
  140009. "attributes": {
  140010. "module_not_derived": "00000000000000000000000000000001",
  140011. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140012. },
  140013. "port_directions": {
  140014. "I0": "input",
  140015. "I1": "input",
  140016. "I2": "input",
  140017. "I3": "input",
  140018. "O": "output"
  140019. },
  140020. "connections": {
  140021. "I0": [ 5608 ],
  140022. "I1": [ 5820 ],
  140023. "I2": [ 5622 ],
  140024. "I3": [ 5418 ],
  140025. "O": [ 5819 ]
  140026. }
  140027. },
  140028. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_13_I2_SB_LUT4_O_1": {
  140029. "hide_name": 0,
  140030. "type": "SB_LUT4",
  140031. "parameters": {
  140032. "LUT_INIT": "1100101000000000"
  140033. },
  140034. "attributes": {
  140035. "module_not_derived": "00000000000000000000000000000001",
  140036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140037. },
  140038. "port_directions": {
  140039. "I0": "input",
  140040. "I1": "input",
  140041. "I2": "input",
  140042. "I3": "input",
  140043. "O": "output"
  140044. },
  140045. "connections": {
  140046. "I0": [ 479 ],
  140047. "I1": [ 365 ],
  140048. "I2": [ 647 ],
  140049. "I3": [ 5419 ],
  140050. "O": [ 5818 ]
  140051. }
  140052. },
  140053. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_13_I2_SB_LUT4_O_I1_SB_DFFER_Q": {
  140054. "hide_name": 0,
  140055. "type": "SB_DFFER",
  140056. "parameters": {
  140057. },
  140058. "attributes": {
  140059. "module_not_derived": "00000000000000000000000000000001",
  140060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140061. },
  140062. "port_directions": {
  140063. "C": "input",
  140064. "D": "input",
  140065. "E": "input",
  140066. "Q": "output",
  140067. "R": "input"
  140068. },
  140069. "connections": {
  140070. "C": [ 42 ],
  140071. "D": [ 67 ],
  140072. "E": [ 5392 ],
  140073. "Q": [ 5820 ],
  140074. "R": [ 127 ]
  140075. }
  140076. },
  140077. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_14": {
  140078. "hide_name": 0,
  140079. "type": "SB_LUT4",
  140080. "parameters": {
  140081. "LUT_INIT": "1111100011111111"
  140082. },
  140083. "attributes": {
  140084. "module_not_derived": "00000000000000000000000000000001",
  140085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140086. },
  140087. "port_directions": {
  140088. "I0": "input",
  140089. "I1": "input",
  140090. "I2": "input",
  140091. "I3": "input",
  140092. "O": "output"
  140093. },
  140094. "connections": {
  140095. "I0": [ 260 ],
  140096. "I1": [ 122 ],
  140097. "I2": [ 5821 ],
  140098. "I3": [ 5822 ],
  140099. "O": [ 5597 ]
  140100. }
  140101. },
  140102. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_14_I2_SB_LUT4_O": {
  140103. "hide_name": 0,
  140104. "type": "SB_LUT4",
  140105. "parameters": {
  140106. "LUT_INIT": "0001001101011111"
  140107. },
  140108. "attributes": {
  140109. "module_not_derived": "00000000000000000000000000000001",
  140110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140111. },
  140112. "port_directions": {
  140113. "I0": "input",
  140114. "I1": "input",
  140115. "I2": "input",
  140116. "I3": "input",
  140117. "O": "output"
  140118. },
  140119. "connections": {
  140120. "I0": [ 5606 ],
  140121. "I1": [ 5823 ],
  140122. "I2": [ 5622 ],
  140123. "I3": [ 5418 ],
  140124. "O": [ 5822 ]
  140125. }
  140126. },
  140127. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_14_I2_SB_LUT4_O_1": {
  140128. "hide_name": 0,
  140129. "type": "SB_LUT4",
  140130. "parameters": {
  140131. "LUT_INIT": "1100101000000000"
  140132. },
  140133. "attributes": {
  140134. "module_not_derived": "00000000000000000000000000000001",
  140135. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140136. },
  140137. "port_directions": {
  140138. "I0": "input",
  140139. "I1": "input",
  140140. "I2": "input",
  140141. "I3": "input",
  140142. "O": "output"
  140143. },
  140144. "connections": {
  140145. "I0": [ 478 ],
  140146. "I1": [ 364 ],
  140147. "I2": [ 647 ],
  140148. "I3": [ 5419 ],
  140149. "O": [ 5821 ]
  140150. }
  140151. },
  140152. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_14_I2_SB_LUT4_O_I1_SB_DFFER_Q": {
  140153. "hide_name": 0,
  140154. "type": "SB_DFFER",
  140155. "parameters": {
  140156. },
  140157. "attributes": {
  140158. "module_not_derived": "00000000000000000000000000000001",
  140159. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140160. },
  140161. "port_directions": {
  140162. "C": "input",
  140163. "D": "input",
  140164. "E": "input",
  140165. "Q": "output",
  140166. "R": "input"
  140167. },
  140168. "connections": {
  140169. "C": [ 42 ],
  140170. "D": [ 75 ],
  140171. "E": [ 5392 ],
  140172. "Q": [ 5823 ],
  140173. "R": [ 127 ]
  140174. }
  140175. },
  140176. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15": {
  140177. "hide_name": 0,
  140178. "type": "SB_LUT4",
  140179. "parameters": {
  140180. "LUT_INIT": "1111001111111111"
  140181. },
  140182. "attributes": {
  140183. "module_not_derived": "00000000000000000000000000000001",
  140184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140185. },
  140186. "port_directions": {
  140187. "I0": "input",
  140188. "I1": "input",
  140189. "I2": "input",
  140190. "I3": "input",
  140191. "O": "output"
  140192. },
  140193. "connections": {
  140194. "I0": [ "0" ],
  140195. "I1": [ 5824 ],
  140196. "I2": [ 5825 ],
  140197. "I3": [ 5826 ],
  140198. "O": [ 5595 ]
  140199. }
  140200. },
  140201. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15_I1_SB_LUT4_O": {
  140202. "hide_name": 0,
  140203. "type": "SB_LUT4",
  140204. "parameters": {
  140205. "LUT_INIT": "1111111100011101"
  140206. },
  140207. "attributes": {
  140208. "module_not_derived": "00000000000000000000000000000001",
  140209. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140210. },
  140211. "port_directions": {
  140212. "I0": "input",
  140213. "I1": "input",
  140214. "I2": "input",
  140215. "I3": "input",
  140216. "O": "output"
  140217. },
  140218. "connections": {
  140219. "I0": [ 5604 ],
  140220. "I1": [ 5551 ],
  140221. "I2": [ 5592 ],
  140222. "I3": [ 5390 ],
  140223. "O": [ 5824 ]
  140224. }
  140225. },
  140226. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15_I1_SB_LUT4_O_1": {
  140227. "hide_name": 0,
  140228. "type": "SB_LUT4",
  140229. "parameters": {
  140230. "LUT_INIT": "0001010100111111"
  140231. },
  140232. "attributes": {
  140233. "module_not_derived": "00000000000000000000000000000001",
  140234. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140235. },
  140236. "port_directions": {
  140237. "I0": "input",
  140238. "I1": "input",
  140239. "I2": "input",
  140240. "I3": "input",
  140241. "O": "output"
  140242. },
  140243. "connections": {
  140244. "I0": [ 184 ],
  140245. "I1": [ 5827 ],
  140246. "I2": [ 5418 ],
  140247. "I3": [ 122 ],
  140248. "O": [ 5826 ]
  140249. }
  140250. },
  140251. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15_I1_SB_LUT4_O_1_I1_SB_DFFER_Q": {
  140252. "hide_name": 0,
  140253. "type": "SB_DFFER",
  140254. "parameters": {
  140255. },
  140256. "attributes": {
  140257. "module_not_derived": "00000000000000000000000000000001",
  140258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140259. },
  140260. "port_directions": {
  140261. "C": "input",
  140262. "D": "input",
  140263. "E": "input",
  140264. "Q": "output",
  140265. "R": "input"
  140266. },
  140267. "connections": {
  140268. "C": [ 42 ],
  140269. "D": [ 95 ],
  140270. "E": [ 5392 ],
  140271. "Q": [ 5827 ],
  140272. "R": [ 127 ]
  140273. }
  140274. },
  140275. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15_I1_SB_LUT4_O_2": {
  140276. "hide_name": 0,
  140277. "type": "SB_LUT4",
  140278. "parameters": {
  140279. "LUT_INIT": "1100101000000000"
  140280. },
  140281. "attributes": {
  140282. "module_not_derived": "00000000000000000000000000000001",
  140283. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140284. },
  140285. "port_directions": {
  140286. "I0": "input",
  140287. "I1": "input",
  140288. "I2": "input",
  140289. "I3": "input",
  140290. "O": "output"
  140291. },
  140292. "connections": {
  140293. "I0": [ 477 ],
  140294. "I1": [ 373 ],
  140295. "I2": [ 647 ],
  140296. "I3": [ 5419 ],
  140297. "O": [ 5825 ]
  140298. }
  140299. },
  140300. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16": {
  140301. "hide_name": 0,
  140302. "type": "SB_LUT4",
  140303. "parameters": {
  140304. "LUT_INIT": "1100111111111111"
  140305. },
  140306. "attributes": {
  140307. "module_not_derived": "00000000000000000000000000000001",
  140308. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140309. },
  140310. "port_directions": {
  140311. "I0": "input",
  140312. "I1": "input",
  140313. "I2": "input",
  140314. "I3": "input",
  140315. "O": "output"
  140316. },
  140317. "connections": {
  140318. "I0": [ "0" ],
  140319. "I1": [ 5828 ],
  140320. "I2": [ 5829 ],
  140321. "I3": [ 5830 ],
  140322. "O": [ 5728 ]
  140323. }
  140324. },
  140325. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16_I1_SB_LUT4_O": {
  140326. "hide_name": 0,
  140327. "type": "SB_LUT4",
  140328. "parameters": {
  140329. "LUT_INIT": "0001001101011111"
  140330. },
  140331. "attributes": {
  140332. "module_not_derived": "00000000000000000000000000000001",
  140333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140334. },
  140335. "port_directions": {
  140336. "I0": "input",
  140337. "I1": "input",
  140338. "I2": "input",
  140339. "I3": "input",
  140340. "O": "output"
  140341. },
  140342. "connections": {
  140343. "I0": [ 5590 ],
  140344. "I1": [ 5831 ],
  140345. "I2": [ 5613 ],
  140346. "I3": [ 5418 ],
  140347. "O": [ 5829 ]
  140348. }
  140349. },
  140350. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16_I1_SB_LUT4_O_1": {
  140351. "hide_name": 0,
  140352. "type": "SB_LUT4",
  140353. "parameters": {
  140354. "LUT_INIT": "0001010100111111"
  140355. },
  140356. "attributes": {
  140357. "module_not_derived": "00000000000000000000000000000001",
  140358. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140359. },
  140360. "port_directions": {
  140361. "I0": "input",
  140362. "I1": "input",
  140363. "I2": "input",
  140364. "I3": "input",
  140365. "O": "output"
  140366. },
  140367. "connections": {
  140368. "I0": [ 185 ],
  140369. "I1": [ 5602 ],
  140370. "I2": [ 5622 ],
  140371. "I3": [ 122 ],
  140372. "O": [ 5830 ]
  140373. }
  140374. },
  140375. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16_I1_SB_LUT4_O_2": {
  140376. "hide_name": 0,
  140377. "type": "SB_LUT4",
  140378. "parameters": {
  140379. "LUT_INIT": "1100101000000000"
  140380. },
  140381. "attributes": {
  140382. "module_not_derived": "00000000000000000000000000000001",
  140383. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140384. },
  140385. "port_directions": {
  140386. "I0": "input",
  140387. "I1": "input",
  140388. "I2": "input",
  140389. "I3": "input",
  140390. "O": "output"
  140391. },
  140392. "connections": {
  140393. "I0": [ 476 ],
  140394. "I1": [ 372 ],
  140395. "I2": [ 647 ],
  140396. "I3": [ 5419 ],
  140397. "O": [ 5828 ]
  140398. }
  140399. },
  140400. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16_I1_SB_LUT4_O_I1_SB_DFFER_Q": {
  140401. "hide_name": 0,
  140402. "type": "SB_DFFER",
  140403. "parameters": {
  140404. },
  140405. "attributes": {
  140406. "module_not_derived": "00000000000000000000000000000001",
  140407. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140408. },
  140409. "port_directions": {
  140410. "C": "input",
  140411. "D": "input",
  140412. "E": "input",
  140413. "Q": "output",
  140414. "R": "input"
  140415. },
  140416. "connections": {
  140417. "C": [ 42 ],
  140418. "D": [ 103 ],
  140419. "E": [ 5392 ],
  140420. "Q": [ 5831 ],
  140421. "R": [ 127 ]
  140422. }
  140423. },
  140424. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17": {
  140425. "hide_name": 0,
  140426. "type": "SB_LUT4",
  140427. "parameters": {
  140428. "LUT_INIT": "1100111111111111"
  140429. },
  140430. "attributes": {
  140431. "module_not_derived": "00000000000000000000000000000001",
  140432. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140433. },
  140434. "port_directions": {
  140435. "I0": "input",
  140436. "I1": "input",
  140437. "I2": "input",
  140438. "I3": "input",
  140439. "O": "output"
  140440. },
  140441. "connections": {
  140442. "I0": [ "0" ],
  140443. "I1": [ 5832 ],
  140444. "I2": [ 5833 ],
  140445. "I3": [ 5834 ],
  140446. "O": [ 5789 ]
  140447. }
  140448. },
  140449. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17_I1_SB_LUT4_O": {
  140450. "hide_name": 0,
  140451. "type": "SB_LUT4",
  140452. "parameters": {
  140453. "LUT_INIT": "0001001101011111"
  140454. },
  140455. "attributes": {
  140456. "module_not_derived": "00000000000000000000000000000001",
  140457. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140458. },
  140459. "port_directions": {
  140460. "I0": "input",
  140461. "I1": "input",
  140462. "I2": "input",
  140463. "I3": "input",
  140464. "O": "output"
  140465. },
  140466. "connections": {
  140467. "I0": [ 5588 ],
  140468. "I1": [ 5835 ],
  140469. "I2": [ 5613 ],
  140470. "I3": [ 5418 ],
  140471. "O": [ 5833 ]
  140472. }
  140473. },
  140474. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17_I1_SB_LUT4_O_1": {
  140475. "hide_name": 0,
  140476. "type": "SB_LUT4",
  140477. "parameters": {
  140478. "LUT_INIT": "0001010100111111"
  140479. },
  140480. "attributes": {
  140481. "module_not_derived": "00000000000000000000000000000001",
  140482. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140483. },
  140484. "port_directions": {
  140485. "I0": "input",
  140486. "I1": "input",
  140487. "I2": "input",
  140488. "I3": "input",
  140489. "O": "output"
  140490. },
  140491. "connections": {
  140492. "I0": [ 186 ],
  140493. "I1": [ 5600 ],
  140494. "I2": [ 5622 ],
  140495. "I3": [ 122 ],
  140496. "O": [ 5834 ]
  140497. }
  140498. },
  140499. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17_I1_SB_LUT4_O_2": {
  140500. "hide_name": 0,
  140501. "type": "SB_LUT4",
  140502. "parameters": {
  140503. "LUT_INIT": "1100101000000000"
  140504. },
  140505. "attributes": {
  140506. "module_not_derived": "00000000000000000000000000000001",
  140507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140508. },
  140509. "port_directions": {
  140510. "I0": "input",
  140511. "I1": "input",
  140512. "I2": "input",
  140513. "I3": "input",
  140514. "O": "output"
  140515. },
  140516. "connections": {
  140517. "I0": [ 475 ],
  140518. "I1": [ 371 ],
  140519. "I2": [ 647 ],
  140520. "I3": [ 5419 ],
  140521. "O": [ 5832 ]
  140522. }
  140523. },
  140524. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17_I1_SB_LUT4_O_I1_SB_DFFER_Q": {
  140525. "hide_name": 0,
  140526. "type": "SB_DFFER",
  140527. "parameters": {
  140528. },
  140529. "attributes": {
  140530. "module_not_derived": "00000000000000000000000000000001",
  140531. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140532. },
  140533. "port_directions": {
  140534. "C": "input",
  140535. "D": "input",
  140536. "E": "input",
  140537. "Q": "output",
  140538. "R": "input"
  140539. },
  140540. "connections": {
  140541. "C": [ 42 ],
  140542. "D": [ 99 ],
  140543. "E": [ 5392 ],
  140544. "Q": [ 5835 ],
  140545. "R": [ 127 ]
  140546. }
  140547. },
  140548. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18": {
  140549. "hide_name": 0,
  140550. "type": "SB_LUT4",
  140551. "parameters": {
  140552. "LUT_INIT": "1111001111111111"
  140553. },
  140554. "attributes": {
  140555. "module_not_derived": "00000000000000000000000000000001",
  140556. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140557. },
  140558. "port_directions": {
  140559. "I0": "input",
  140560. "I1": "input",
  140561. "I2": "input",
  140562. "I3": "input",
  140563. "O": "output"
  140564. },
  140565. "connections": {
  140566. "I0": [ "0" ],
  140567. "I1": [ 5836 ],
  140568. "I2": [ 5837 ],
  140569. "I3": [ 5838 ],
  140570. "O": [ 5839 ]
  140571. }
  140572. },
  140573. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18_I1_SB_LUT4_O": {
  140574. "hide_name": 0,
  140575. "type": "SB_LUT4",
  140576. "parameters": {
  140577. "LUT_INIT": "1111111100110101"
  140578. },
  140579. "attributes": {
  140580. "module_not_derived": "00000000000000000000000000000001",
  140581. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140582. },
  140583. "port_directions": {
  140584. "I0": "input",
  140585. "I1": "input",
  140586. "I2": "input",
  140587. "I3": "input",
  140588. "O": "output"
  140589. },
  140590. "connections": {
  140591. "I0": [ 5598 ],
  140592. "I1": [ 5586 ],
  140593. "I2": [ 5551 ],
  140594. "I3": [ 5390 ],
  140595. "O": [ 5836 ]
  140596. }
  140597. },
  140598. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18_I1_SB_LUT4_O_1": {
  140599. "hide_name": 0,
  140600. "type": "SB_LUT4",
  140601. "parameters": {
  140602. "LUT_INIT": "0001010100111111"
  140603. },
  140604. "attributes": {
  140605. "module_not_derived": "00000000000000000000000000000001",
  140606. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140607. },
  140608. "port_directions": {
  140609. "I0": "input",
  140610. "I1": "input",
  140611. "I2": "input",
  140612. "I3": "input",
  140613. "O": "output"
  140614. },
  140615. "connections": {
  140616. "I0": [ 187 ],
  140617. "I1": [ 5840 ],
  140618. "I2": [ 5418 ],
  140619. "I3": [ 122 ],
  140620. "O": [ 5838 ]
  140621. }
  140622. },
  140623. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18_I1_SB_LUT4_O_1_I1_SB_DFFER_Q": {
  140624. "hide_name": 0,
  140625. "type": "SB_DFFER",
  140626. "parameters": {
  140627. },
  140628. "attributes": {
  140629. "module_not_derived": "00000000000000000000000000000001",
  140630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140631. },
  140632. "port_directions": {
  140633. "C": "input",
  140634. "D": "input",
  140635. "E": "input",
  140636. "Q": "output",
  140637. "R": "input"
  140638. },
  140639. "connections": {
  140640. "C": [ 42 ],
  140641. "D": [ 107 ],
  140642. "E": [ 5392 ],
  140643. "Q": [ 5840 ],
  140644. "R": [ 127 ]
  140645. }
  140646. },
  140647. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18_I1_SB_LUT4_O_2": {
  140648. "hide_name": 0,
  140649. "type": "SB_LUT4",
  140650. "parameters": {
  140651. "LUT_INIT": "1100101000000000"
  140652. },
  140653. "attributes": {
  140654. "module_not_derived": "00000000000000000000000000000001",
  140655. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140656. },
  140657. "port_directions": {
  140658. "I0": "input",
  140659. "I1": "input",
  140660. "I2": "input",
  140661. "I3": "input",
  140662. "O": "output"
  140663. },
  140664. "connections": {
  140665. "I0": [ 474 ],
  140666. "I1": [ 370 ],
  140667. "I2": [ 647 ],
  140668. "I3": [ 5419 ],
  140669. "O": [ 5837 ]
  140670. }
  140671. },
  140672. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_19": {
  140673. "hide_name": 0,
  140674. "type": "SB_LUT4",
  140675. "parameters": {
  140676. "LUT_INIT": "1100111111111111"
  140677. },
  140678. "attributes": {
  140679. "module_not_derived": "00000000000000000000000000000001",
  140680. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140681. },
  140682. "port_directions": {
  140683. "I0": "input",
  140684. "I1": "input",
  140685. "I2": "input",
  140686. "I3": "input",
  140687. "O": "output"
  140688. },
  140689. "connections": {
  140690. "I0": [ "0" ],
  140691. "I1": [ 5841 ],
  140692. "I2": [ 5842 ],
  140693. "I3": [ 5843 ],
  140694. "O": [ 5593 ]
  140695. }
  140696. },
  140697. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_19_I1_SB_LUT4_O": {
  140698. "hide_name": 0,
  140699. "type": "SB_LUT4",
  140700. "parameters": {
  140701. "LUT_INIT": "0001001101011111"
  140702. },
  140703. "attributes": {
  140704. "module_not_derived": "00000000000000000000000000000001",
  140705. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140706. },
  140707. "port_directions": {
  140708. "I0": "input",
  140709. "I1": "input",
  140710. "I2": "input",
  140711. "I3": "input",
  140712. "O": "output"
  140713. },
  140714. "connections": {
  140715. "I0": [ 5584 ],
  140716. "I1": [ 5795 ],
  140717. "I2": [ 5613 ],
  140718. "I3": [ 5418 ],
  140719. "O": [ 5842 ]
  140720. }
  140721. },
  140722. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_19_I1_SB_LUT4_O_1": {
  140723. "hide_name": 0,
  140724. "type": "SB_LUT4",
  140725. "parameters": {
  140726. "LUT_INIT": "0001010100111111"
  140727. },
  140728. "attributes": {
  140729. "module_not_derived": "00000000000000000000000000000001",
  140730. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140731. },
  140732. "port_directions": {
  140733. "I0": "input",
  140734. "I1": "input",
  140735. "I2": "input",
  140736. "I3": "input",
  140737. "O": "output"
  140738. },
  140739. "connections": {
  140740. "I0": [ 253 ],
  140741. "I1": [ 5596 ],
  140742. "I2": [ 5622 ],
  140743. "I3": [ 122 ],
  140744. "O": [ 5843 ]
  140745. }
  140746. },
  140747. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_19_I1_SB_LUT4_O_2": {
  140748. "hide_name": 0,
  140749. "type": "SB_LUT4",
  140750. "parameters": {
  140751. "LUT_INIT": "1100101000000000"
  140752. },
  140753. "attributes": {
  140754. "module_not_derived": "00000000000000000000000000000001",
  140755. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140756. },
  140757. "port_directions": {
  140758. "I0": "input",
  140759. "I1": "input",
  140760. "I2": "input",
  140761. "I3": "input",
  140762. "O": "output"
  140763. },
  140764. "connections": {
  140765. "I0": [ 485 ],
  140766. "I1": [ 369 ],
  140767. "I2": [ 647 ],
  140768. "I3": [ 5419 ],
  140769. "O": [ 5841 ]
  140770. }
  140771. },
  140772. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_1_I1_SB_DFFER_Q": {
  140773. "hide_name": 0,
  140774. "type": "SB_DFFER",
  140775. "parameters": {
  140776. },
  140777. "attributes": {
  140778. "module_not_derived": "00000000000000000000000000000001",
  140779. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  140780. },
  140781. "port_directions": {
  140782. "C": "input",
  140783. "D": "input",
  140784. "E": "input",
  140785. "Q": "output",
  140786. "R": "input"
  140787. },
  140788. "connections": {
  140789. "C": [ 42 ],
  140790. "D": [ 64 ],
  140791. "E": [ 5392 ],
  140792. "Q": [ 5808 ],
  140793. "R": [ 127 ]
  140794. }
  140795. },
  140796. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_2": {
  140797. "hide_name": 0,
  140798. "type": "SB_LUT4",
  140799. "parameters": {
  140800. "LUT_INIT": "1110101011000000"
  140801. },
  140802. "attributes": {
  140803. "module_not_derived": "00000000000000000000000000000001",
  140804. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140805. },
  140806. "port_directions": {
  140807. "I0": "input",
  140808. "I1": "input",
  140809. "I2": "input",
  140810. "I3": "input",
  140811. "O": "output"
  140812. },
  140813. "connections": {
  140814. "I0": [ 195 ],
  140815. "I1": [ 5844 ],
  140816. "I2": [ 5418 ],
  140817. "I3": [ 122 ],
  140818. "O": [ 5585 ]
  140819. }
  140820. },
  140821. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_20": {
  140822. "hide_name": 0,
  140823. "type": "SB_LUT4",
  140824. "parameters": {
  140825. "LUT_INIT": "1111001111111111"
  140826. },
  140827. "attributes": {
  140828. "module_not_derived": "00000000000000000000000000000001",
  140829. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140830. },
  140831. "port_directions": {
  140832. "I0": "input",
  140833. "I1": "input",
  140834. "I2": "input",
  140835. "I3": "input",
  140836. "O": "output"
  140837. },
  140838. "connections": {
  140839. "I0": [ "0" ],
  140840. "I1": [ 5730 ],
  140841. "I2": [ 5733 ],
  140842. "I3": [ 5732 ],
  140843. "O": [ 5735 ]
  140844. }
  140845. },
  140846. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_21": {
  140847. "hide_name": 0,
  140848. "type": "SB_LUT4",
  140849. "parameters": {
  140850. "LUT_INIT": "1100111111111111"
  140851. },
  140852. "attributes": {
  140853. "module_not_derived": "00000000000000000000000000000001",
  140854. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140855. },
  140856. "port_directions": {
  140857. "I0": "input",
  140858. "I1": "input",
  140859. "I2": "input",
  140860. "I3": "input",
  140861. "O": "output"
  140862. },
  140863. "connections": {
  140864. "I0": [ "0" ],
  140865. "I1": [ 5794 ],
  140866. "I2": [ 5793 ],
  140867. "I3": [ 5791 ],
  140868. "O": [ 5797 ]
  140869. }
  140870. },
  140871. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_22": {
  140872. "hide_name": 0,
  140873. "type": "SB_LUT4",
  140874. "parameters": {
  140875. "LUT_INIT": "1100111111111111"
  140876. },
  140877. "attributes": {
  140878. "module_not_derived": "00000000000000000000000000000001",
  140879. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140880. },
  140881. "port_directions": {
  140882. "I0": "input",
  140883. "I1": "input",
  140884. "I2": "input",
  140885. "I3": "input",
  140886. "O": "output"
  140887. },
  140888. "connections": {
  140889. "I0": [ "0" ],
  140890. "I1": [ 5845 ],
  140891. "I2": [ 5846 ],
  140892. "I3": [ 5847 ],
  140893. "O": [ 5848 ]
  140894. }
  140895. },
  140896. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_23": {
  140897. "hide_name": 0,
  140898. "type": "SB_LUT4",
  140899. "parameters": {
  140900. "LUT_INIT": "1111111100111111"
  140901. },
  140902. "attributes": {
  140903. "module_not_derived": "00000000000000000000000000000001",
  140904. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  140905. },
  140906. "port_directions": {
  140907. "I0": "input",
  140908. "I1": "input",
  140909. "I2": "input",
  140910. "I3": "input",
  140911. "O": "output"
  140912. },
  140913. "connections": {
  140914. "I0": [ "0" ],
  140915. "I1": [ 5743 ],
  140916. "I2": [ 5744 ],
  140917. "I3": [ 5741 ],
  140918. "O": [ 5571 ]
  140919. }
  140920. },
  140921. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_24": {
  140922. "hide_name": 0,
  140923. "type": "SB_LUT4",
  140924. "parameters": {
  140925. "LUT_INIT": "1111100011111111"
  140926. },
  140927. "attributes": {
  140928. "module_not_derived": "00000000000000000000000000000001",
  140929. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140930. },
  140931. "port_directions": {
  140932. "I0": "input",
  140933. "I1": "input",
  140934. "I2": "input",
  140935. "I3": "input",
  140936. "O": "output"
  140937. },
  140938. "connections": {
  140939. "I0": [ 5800 ],
  140940. "I1": [ 5418 ],
  140941. "I2": [ 5801 ],
  140942. "I3": [ 5799 ],
  140943. "O": [ 5803 ]
  140944. }
  140945. },
  140946. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_25": {
  140947. "hide_name": 0,
  140948. "type": "SB_LUT4",
  140949. "parameters": {
  140950. "LUT_INIT": "1111100011111111"
  140951. },
  140952. "attributes": {
  140953. "module_not_derived": "00000000000000000000000000000001",
  140954. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140955. },
  140956. "port_directions": {
  140957. "I0": "input",
  140958. "I1": "input",
  140959. "I2": "input",
  140960. "I3": "input",
  140961. "O": "output"
  140962. },
  140963. "connections": {
  140964. "I0": [ 5572 ],
  140965. "I1": [ 5622 ],
  140966. "I2": [ 5849 ],
  140967. "I3": [ 5850 ],
  140968. "O": [ 5569 ]
  140969. }
  140970. },
  140971. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_25_I2_SB_LUT4_O": {
  140972. "hide_name": 0,
  140973. "type": "SB_LUT4",
  140974. "parameters": {
  140975. "LUT_INIT": "0001010100111111"
  140976. },
  140977. "attributes": {
  140978. "module_not_derived": "00000000000000000000000000000001",
  140979. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  140980. },
  140981. "port_directions": {
  140982. "I0": "input",
  140983. "I1": "input",
  140984. "I2": "input",
  140985. "I3": "input",
  140986. "O": "output"
  140987. },
  140988. "connections": {
  140989. "I0": [ 249 ],
  140990. "I1": [ 5851 ],
  140991. "I2": [ 5418 ],
  140992. "I3": [ 122 ],
  140993. "O": [ 5850 ]
  140994. }
  140995. },
  140996. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_25_I2_SB_LUT4_O_1": {
  140997. "hide_name": 0,
  140998. "type": "SB_LUT4",
  140999. "parameters": {
  141000. "LUT_INIT": "1111000000000000"
  141001. },
  141002. "attributes": {
  141003. "module_not_derived": "00000000000000000000000000000001",
  141004. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141005. },
  141006. "port_directions": {
  141007. "I0": "input",
  141008. "I1": "input",
  141009. "I2": "input",
  141010. "I3": "input",
  141011. "O": "output"
  141012. },
  141013. "connections": {
  141014. "I0": [ "0" ],
  141015. "I1": [ "0" ],
  141016. "I2": [ 5604 ],
  141017. "I3": [ 5613 ],
  141018. "O": [ 5849 ]
  141019. }
  141020. },
  141021. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_25_I2_SB_LUT4_O_I1_SB_DFFER_Q": {
  141022. "hide_name": 0,
  141023. "type": "SB_DFFER",
  141024. "parameters": {
  141025. },
  141026. "attributes": {
  141027. "module_not_derived": "00000000000000000000000000000001",
  141028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141029. },
  141030. "port_directions": {
  141031. "C": "input",
  141032. "D": "input",
  141033. "E": "input",
  141034. "Q": "output",
  141035. "R": "input"
  141036. },
  141037. "connections": {
  141038. "C": [ 42 ],
  141039. "D": [ 98 ],
  141040. "E": [ 5392 ],
  141041. "Q": [ 5851 ],
  141042. "R": [ 127 ]
  141043. }
  141044. },
  141045. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_26": {
  141046. "hide_name": 0,
  141047. "type": "SB_LUT4",
  141048. "parameters": {
  141049. "LUT_INIT": "1111111100111111"
  141050. },
  141051. "attributes": {
  141052. "module_not_derived": "00000000000000000000000000000001",
  141053. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  141054. },
  141055. "port_directions": {
  141056. "I0": "input",
  141057. "I1": "input",
  141058. "I2": "input",
  141059. "I3": "input",
  141060. "O": "output"
  141061. },
  141062. "connections": {
  141063. "I0": [ "0" ],
  141064. "I1": [ 5852 ],
  141065. "I2": [ 5853 ],
  141066. "I3": [ 5750 ],
  141067. "O": [ 5854 ]
  141068. }
  141069. },
  141070. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_27": {
  141071. "hide_name": 0,
  141072. "type": "SB_LUT4",
  141073. "parameters": {
  141074. "LUT_INIT": "1110101011000000"
  141075. },
  141076. "attributes": {
  141077. "module_not_derived": "00000000000000000000000000000001",
  141078. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141079. },
  141080. "port_directions": {
  141081. "I0": "input",
  141082. "I1": "input",
  141083. "I2": "input",
  141084. "I3": "input",
  141085. "O": "output"
  141086. },
  141087. "connections": {
  141088. "I0": [ 192 ],
  141089. "I1": [ 5855 ],
  141090. "I2": [ 5418 ],
  141091. "I3": [ 122 ],
  141092. "O": [ 5591 ]
  141093. }
  141094. },
  141095. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_27_I1_SB_DFFER_Q": {
  141096. "hide_name": 0,
  141097. "type": "SB_DFFER",
  141098. "parameters": {
  141099. },
  141100. "attributes": {
  141101. "module_not_derived": "00000000000000000000000000000001",
  141102. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141103. },
  141104. "port_directions": {
  141105. "C": "input",
  141106. "D": "input",
  141107. "E": "input",
  141108. "Q": "output",
  141109. "R": "input"
  141110. },
  141111. "connections": {
  141112. "C": [ 42 ],
  141113. "D": [ 60 ],
  141114. "E": [ 5392 ],
  141115. "Q": [ 5855 ],
  141116. "R": [ 127 ]
  141117. }
  141118. },
  141119. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_2_I1_SB_DFFER_Q": {
  141120. "hide_name": 0,
  141121. "type": "SB_DFFER",
  141122. "parameters": {
  141123. },
  141124. "attributes": {
  141125. "module_not_derived": "00000000000000000000000000000001",
  141126. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141127. },
  141128. "port_directions": {
  141129. "C": "input",
  141130. "D": "input",
  141131. "E": "input",
  141132. "Q": "output",
  141133. "R": "input"
  141134. },
  141135. "connections": {
  141136. "C": [ 42 ],
  141137. "D": [ 72 ],
  141138. "E": [ 5392 ],
  141139. "Q": [ 5844 ],
  141140. "R": [ 127 ]
  141141. }
  141142. },
  141143. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_3": {
  141144. "hide_name": 0,
  141145. "type": "SB_LUT4",
  141146. "parameters": {
  141147. "LUT_INIT": "1100000011111111"
  141148. },
  141149. "attributes": {
  141150. "module_not_derived": "00000000000000000000000000000001",
  141151. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  141152. },
  141153. "port_directions": {
  141154. "I0": "input",
  141155. "I1": "input",
  141156. "I2": "input",
  141157. "I3": "input",
  141158. "O": "output"
  141159. },
  141160. "connections": {
  141161. "I0": [ "0" ],
  141162. "I1": [ 261 ],
  141163. "I2": [ 122 ],
  141164. "I3": [ 5856 ],
  141165. "O": [ 5583 ]
  141166. }
  141167. },
  141168. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_3_I3_SB_LUT4_O": {
  141169. "hide_name": 0,
  141170. "type": "SB_LUT4",
  141171. "parameters": {
  141172. "LUT_INIT": "0001001101011111"
  141173. },
  141174. "attributes": {
  141175. "module_not_derived": "00000000000000000000000000000001",
  141176. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141177. },
  141178. "port_directions": {
  141179. "I0": "input",
  141180. "I1": "input",
  141181. "I2": "input",
  141182. "I3": "input",
  141183. "O": "output"
  141184. },
  141185. "connections": {
  141186. "I0": [ 5592 ],
  141187. "I1": [ 5857 ],
  141188. "I2": [ 5622 ],
  141189. "I3": [ 5418 ],
  141190. "O": [ 5856 ]
  141191. }
  141192. },
  141193. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_DFFER_Q": {
  141194. "hide_name": 0,
  141195. "type": "SB_DFFER",
  141196. "parameters": {
  141197. },
  141198. "attributes": {
  141199. "module_not_derived": "00000000000000000000000000000001",
  141200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141201. },
  141202. "port_directions": {
  141203. "C": "input",
  141204. "D": "input",
  141205. "E": "input",
  141206. "Q": "output",
  141207. "R": "input"
  141208. },
  141209. "connections": {
  141210. "C": [ 42 ],
  141211. "D": [ 62 ],
  141212. "E": [ 5392 ],
  141213. "Q": [ 5857 ],
  141214. "R": [ 127 ]
  141215. }
  141216. },
  141217. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_4": {
  141218. "hide_name": 0,
  141219. "type": "SB_LUT4",
  141220. "parameters": {
  141221. "LUT_INIT": "1111100011111111"
  141222. },
  141223. "attributes": {
  141224. "module_not_derived": "00000000000000000000000000000001",
  141225. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141226. },
  141227. "port_directions": {
  141228. "I0": "input",
  141229. "I1": "input",
  141230. "I2": "input",
  141231. "I3": "input",
  141232. "O": "output"
  141233. },
  141234. "connections": {
  141235. "I0": [ 5858 ],
  141236. "I1": [ 5418 ],
  141237. "I2": [ 5859 ],
  141238. "I3": [ 5860 ],
  141239. "O": [ 5581 ]
  141240. }
  141241. },
  141242. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_4_I0_SB_DFFER_Q": {
  141243. "hide_name": 0,
  141244. "type": "SB_DFFER",
  141245. "parameters": {
  141246. },
  141247. "attributes": {
  141248. "module_not_derived": "00000000000000000000000000000001",
  141249. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141250. },
  141251. "port_directions": {
  141252. "C": "input",
  141253. "D": "input",
  141254. "E": "input",
  141255. "Q": "output",
  141256. "R": "input"
  141257. },
  141258. "connections": {
  141259. "C": [ 42 ],
  141260. "D": [ 70 ],
  141261. "E": [ 5392 ],
  141262. "Q": [ 5858 ],
  141263. "R": [ 127 ]
  141264. }
  141265. },
  141266. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_4_I0_SB_LUT4_O": {
  141267. "hide_name": 0,
  141268. "type": "SB_LUT4",
  141269. "parameters": {
  141270. "LUT_INIT": "0001001101011111"
  141271. },
  141272. "attributes": {
  141273. "module_not_derived": "00000000000000000000000000000001",
  141274. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141275. },
  141276. "port_directions": {
  141277. "I0": "input",
  141278. "I1": "input",
  141279. "I2": "input",
  141280. "I3": "input",
  141281. "O": "output"
  141282. },
  141283. "connections": {
  141284. "I0": [ 152 ],
  141285. "I1": [ 5590 ],
  141286. "I2": [ 5419 ],
  141287. "I3": [ 5622 ],
  141288. "O": [ 5860 ]
  141289. }
  141290. },
  141291. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_4_I0_SB_LUT4_O_1": {
  141292. "hide_name": 0,
  141293. "type": "SB_LUT4",
  141294. "parameters": {
  141295. "LUT_INIT": "1111000000000000"
  141296. },
  141297. "attributes": {
  141298. "module_not_derived": "00000000000000000000000000000001",
  141299. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141300. },
  141301. "port_directions": {
  141302. "I0": "input",
  141303. "I1": "input",
  141304. "I2": "input",
  141305. "I3": "input",
  141306. "O": "output"
  141307. },
  141308. "connections": {
  141309. "I0": [ "0" ],
  141310. "I1": [ "0" ],
  141311. "I2": [ 262 ],
  141312. "I3": [ 122 ],
  141313. "O": [ 5859 ]
  141314. }
  141315. },
  141316. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_5": {
  141317. "hide_name": 0,
  141318. "type": "SB_LUT4",
  141319. "parameters": {
  141320. "LUT_INIT": "1111100011111111"
  141321. },
  141322. "attributes": {
  141323. "module_not_derived": "00000000000000000000000000000001",
  141324. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141325. },
  141326. "port_directions": {
  141327. "I0": "input",
  141328. "I1": "input",
  141329. "I2": "input",
  141330. "I3": "input",
  141331. "O": "output"
  141332. },
  141333. "connections": {
  141334. "I0": [ 5588 ],
  141335. "I1": [ 5622 ],
  141336. "I2": [ 5861 ],
  141337. "I3": [ 5862 ],
  141338. "O": [ 5579 ]
  141339. }
  141340. },
  141341. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_5_I2_SB_LUT4_O": {
  141342. "hide_name": 0,
  141343. "type": "SB_LUT4",
  141344. "parameters": {
  141345. "LUT_INIT": "0001001101011111"
  141346. },
  141347. "attributes": {
  141348. "module_not_derived": "00000000000000000000000000000001",
  141349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141350. },
  141351. "port_directions": {
  141352. "I0": "input",
  141353. "I1": "input",
  141354. "I2": "input",
  141355. "I3": "input",
  141356. "O": "output"
  141357. },
  141358. "connections": {
  141359. "I0": [ 153 ],
  141360. "I1": [ 5863 ],
  141361. "I2": [ 5419 ],
  141362. "I3": [ 5418 ],
  141363. "O": [ 5862 ]
  141364. }
  141365. },
  141366. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  141367. "hide_name": 0,
  141368. "type": "SB_LUT4",
  141369. "parameters": {
  141370. "LUT_INIT": "1111000000000000"
  141371. },
  141372. "attributes": {
  141373. "module_not_derived": "00000000000000000000000000000001",
  141374. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141375. },
  141376. "port_directions": {
  141377. "I0": "input",
  141378. "I1": "input",
  141379. "I2": "input",
  141380. "I3": "input",
  141381. "O": "output"
  141382. },
  141383. "connections": {
  141384. "I0": [ "0" ],
  141385. "I1": [ "0" ],
  141386. "I2": [ 263 ],
  141387. "I3": [ 122 ],
  141388. "O": [ 5861 ]
  141389. }
  141390. },
  141391. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_5_I2_SB_LUT4_O_I1_SB_DFFER_Q": {
  141392. "hide_name": 0,
  141393. "type": "SB_DFFER",
  141394. "parameters": {
  141395. },
  141396. "attributes": {
  141397. "module_not_derived": "00000000000000000000000000000001",
  141398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141399. },
  141400. "port_directions": {
  141401. "C": "input",
  141402. "D": "input",
  141403. "E": "input",
  141404. "Q": "output",
  141405. "R": "input"
  141406. },
  141407. "connections": {
  141408. "C": [ 42 ],
  141409. "D": [ 66 ],
  141410. "E": [ 5392 ],
  141411. "Q": [ 5863 ],
  141412. "R": [ 127 ]
  141413. }
  141414. },
  141415. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_6": {
  141416. "hide_name": 0,
  141417. "type": "SB_LUT4",
  141418. "parameters": {
  141419. "LUT_INIT": "1111100011111111"
  141420. },
  141421. "attributes": {
  141422. "module_not_derived": "00000000000000000000000000000001",
  141423. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141424. },
  141425. "port_directions": {
  141426. "I0": "input",
  141427. "I1": "input",
  141428. "I2": "input",
  141429. "I3": "input",
  141430. "O": "output"
  141431. },
  141432. "connections": {
  141433. "I0": [ 5864 ],
  141434. "I1": [ 5418 ],
  141435. "I2": [ 5865 ],
  141436. "I3": [ 5866 ],
  141437. "O": [ 5577 ]
  141438. }
  141439. },
  141440. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_6_I0_SB_DFFER_Q": {
  141441. "hide_name": 0,
  141442. "type": "SB_DFFER",
  141443. "parameters": {
  141444. },
  141445. "attributes": {
  141446. "module_not_derived": "00000000000000000000000000000001",
  141447. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141448. },
  141449. "port_directions": {
  141450. "C": "input",
  141451. "D": "input",
  141452. "E": "input",
  141453. "Q": "output",
  141454. "R": "input"
  141455. },
  141456. "connections": {
  141457. "C": [ 42 ],
  141458. "D": [ 74 ],
  141459. "E": [ 5392 ],
  141460. "Q": [ 5864 ],
  141461. "R": [ 127 ]
  141462. }
  141463. },
  141464. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_6_I0_SB_LUT4_O": {
  141465. "hide_name": 0,
  141466. "type": "SB_LUT4",
  141467. "parameters": {
  141468. "LUT_INIT": "0001001101011111"
  141469. },
  141470. "attributes": {
  141471. "module_not_derived": "00000000000000000000000000000001",
  141472. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141473. },
  141474. "port_directions": {
  141475. "I0": "input",
  141476. "I1": "input",
  141477. "I2": "input",
  141478. "I3": "input",
  141479. "O": "output"
  141480. },
  141481. "connections": {
  141482. "I0": [ 154 ],
  141483. "I1": [ 5586 ],
  141484. "I2": [ 5419 ],
  141485. "I3": [ 5622 ],
  141486. "O": [ 5866 ]
  141487. }
  141488. },
  141489. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_6_I0_SB_LUT4_O_1": {
  141490. "hide_name": 0,
  141491. "type": "SB_LUT4",
  141492. "parameters": {
  141493. "LUT_INIT": "1111000000000000"
  141494. },
  141495. "attributes": {
  141496. "module_not_derived": "00000000000000000000000000000001",
  141497. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141498. },
  141499. "port_directions": {
  141500. "I0": "input",
  141501. "I1": "input",
  141502. "I2": "input",
  141503. "I3": "input",
  141504. "O": "output"
  141505. },
  141506. "connections": {
  141507. "I0": [ "0" ],
  141508. "I1": [ "0" ],
  141509. "I2": [ 264 ],
  141510. "I3": [ 122 ],
  141511. "O": [ 5865 ]
  141512. }
  141513. },
  141514. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_7": {
  141515. "hide_name": 0,
  141516. "type": "SB_LUT4",
  141517. "parameters": {
  141518. "LUT_INIT": "1111100011111111"
  141519. },
  141520. "attributes": {
  141521. "module_not_derived": "00000000000000000000000000000001",
  141522. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141523. },
  141524. "port_directions": {
  141525. "I0": "input",
  141526. "I1": "input",
  141527. "I2": "input",
  141528. "I3": "input",
  141529. "O": "output"
  141530. },
  141531. "connections": {
  141532. "I0": [ 5584 ],
  141533. "I1": [ 5622 ],
  141534. "I2": [ 5624 ],
  141535. "I3": [ 5623 ],
  141536. "O": [ 5575 ]
  141537. }
  141538. },
  141539. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_8": {
  141540. "hide_name": 0,
  141541. "type": "SB_LUT4",
  141542. "parameters": {
  141543. "LUT_INIT": "1111100011111111"
  141544. },
  141545. "attributes": {
  141546. "module_not_derived": "00000000000000000000000000000001",
  141547. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141548. },
  141549. "port_directions": {
  141550. "I0": "input",
  141551. "I1": "input",
  141552. "I2": "input",
  141553. "I3": "input",
  141554. "O": "output"
  141555. },
  141556. "connections": {
  141557. "I0": [ 5582 ],
  141558. "I1": [ 5622 ],
  141559. "I2": [ 5867 ],
  141560. "I3": [ 5868 ],
  141561. "O": [ 5573 ]
  141562. }
  141563. },
  141564. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_8_I2_SB_LUT4_O": {
  141565. "hide_name": 0,
  141566. "type": "SB_LUT4",
  141567. "parameters": {
  141568. "LUT_INIT": "0001001101011111"
  141569. },
  141570. "attributes": {
  141571. "module_not_derived": "00000000000000000000000000000001",
  141572. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141573. },
  141574. "port_directions": {
  141575. "I0": "input",
  141576. "I1": "input",
  141577. "I2": "input",
  141578. "I3": "input",
  141579. "O": "output"
  141580. },
  141581. "connections": {
  141582. "I0": [ 156 ],
  141583. "I1": [ 5869 ],
  141584. "I2": [ 5419 ],
  141585. "I3": [ 5418 ],
  141586. "O": [ 5868 ]
  141587. }
  141588. },
  141589. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_8_I2_SB_LUT4_O_1": {
  141590. "hide_name": 0,
  141591. "type": "SB_LUT4",
  141592. "parameters": {
  141593. "LUT_INIT": "1111000000000000"
  141594. },
  141595. "attributes": {
  141596. "module_not_derived": "00000000000000000000000000000001",
  141597. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141598. },
  141599. "port_directions": {
  141600. "I0": "input",
  141601. "I1": "input",
  141602. "I2": "input",
  141603. "I3": "input",
  141604. "O": "output"
  141605. },
  141606. "connections": {
  141607. "I0": [ "0" ],
  141608. "I1": [ "0" ],
  141609. "I2": [ 189 ],
  141610. "I3": [ 122 ],
  141611. "O": [ 5867 ]
  141612. }
  141613. },
  141614. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_8_I2_SB_LUT4_O_I1_SB_DFFER_Q": {
  141615. "hide_name": 0,
  141616. "type": "SB_DFFER",
  141617. "parameters": {
  141618. },
  141619. "attributes": {
  141620. "module_not_derived": "00000000000000000000000000000001",
  141621. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141622. },
  141623. "port_directions": {
  141624. "C": "input",
  141625. "D": "input",
  141626. "E": "input",
  141627. "Q": "output",
  141628. "R": "input"
  141629. },
  141630. "connections": {
  141631. "C": [ 42 ],
  141632. "D": [ 69 ],
  141633. "E": [ 5392 ],
  141634. "Q": [ 5869 ],
  141635. "R": [ 127 ]
  141636. }
  141637. },
  141638. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_9": {
  141639. "hide_name": 0,
  141640. "type": "SB_LUT4",
  141641. "parameters": {
  141642. "LUT_INIT": "1111100011111111"
  141643. },
  141644. "attributes": {
  141645. "module_not_derived": "00000000000000000000000000000001",
  141646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141647. },
  141648. "port_directions": {
  141649. "I0": "input",
  141650. "I1": "input",
  141651. "I2": "input",
  141652. "I3": "input",
  141653. "O": "output"
  141654. },
  141655. "connections": {
  141656. "I0": [ 5870 ],
  141657. "I1": [ 5418 ],
  141658. "I2": [ 5871 ],
  141659. "I3": [ 5872 ],
  141660. "O": [ 5607 ]
  141661. }
  141662. },
  141663. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_9_I0_SB_DFFER_Q": {
  141664. "hide_name": 0,
  141665. "type": "SB_DFFER",
  141666. "parameters": {
  141667. },
  141668. "attributes": {
  141669. "module_not_derived": "00000000000000000000000000000001",
  141670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141671. },
  141672. "port_directions": {
  141673. "C": "input",
  141674. "D": "input",
  141675. "E": "input",
  141676. "Q": "output",
  141677. "R": "input"
  141678. },
  141679. "connections": {
  141680. "C": [ 42 ],
  141681. "D": [ 65 ],
  141682. "E": [ 5392 ],
  141683. "Q": [ 5870 ],
  141684. "R": [ 127 ]
  141685. }
  141686. },
  141687. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_9_I0_SB_LUT4_O": {
  141688. "hide_name": 0,
  141689. "type": "SB_LUT4",
  141690. "parameters": {
  141691. "LUT_INIT": "0001001101011111"
  141692. },
  141693. "attributes": {
  141694. "module_not_derived": "00000000000000000000000000000001",
  141695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141696. },
  141697. "port_directions": {
  141698. "I0": "input",
  141699. "I1": "input",
  141700. "I2": "input",
  141701. "I3": "input",
  141702. "O": "output"
  141703. },
  141704. "connections": {
  141705. "I0": [ 157 ],
  141706. "I1": [ 5580 ],
  141707. "I2": [ 5419 ],
  141708. "I3": [ 5622 ],
  141709. "O": [ 5872 ]
  141710. }
  141711. },
  141712. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_9_I0_SB_LUT4_O_1": {
  141713. "hide_name": 0,
  141714. "type": "SB_LUT4",
  141715. "parameters": {
  141716. "LUT_INIT": "1111000000000000"
  141717. },
  141718. "attributes": {
  141719. "module_not_derived": "00000000000000000000000000000001",
  141720. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141721. },
  141722. "port_directions": {
  141723. "I0": "input",
  141724. "I1": "input",
  141725. "I2": "input",
  141726. "I3": "input",
  141727. "O": "output"
  141728. },
  141729. "connections": {
  141730. "I0": [ "0" ],
  141731. "I1": [ "0" ],
  141732. "I2": [ 190 ],
  141733. "I3": [ 122 ],
  141734. "O": [ 5871 ]
  141735. }
  141736. },
  141737. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  141738. "hide_name": 0,
  141739. "type": "SB_LUT4",
  141740. "parameters": {
  141741. "LUT_INIT": "0001010100111111"
  141742. },
  141743. "attributes": {
  141744. "module_not_derived": "00000000000000000000000000000001",
  141745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  141746. },
  141747. "port_directions": {
  141748. "I0": "input",
  141749. "I1": "input",
  141750. "I2": "input",
  141751. "I3": "input",
  141752. "O": "output"
  141753. },
  141754. "connections": {
  141755. "I0": [ 251 ],
  141756. "I1": [ 5873 ],
  141757. "I2": [ 5418 ],
  141758. "I3": [ 122 ],
  141759. "O": [ 5806 ]
  141760. }
  141761. },
  141762. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  141763. "hide_name": 0,
  141764. "type": "SB_DFFER",
  141765. "parameters": {
  141766. },
  141767. "attributes": {
  141768. "module_not_derived": "00000000000000000000000000000001",
  141769. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  141770. },
  141771. "port_directions": {
  141772. "C": "input",
  141773. "D": "input",
  141774. "E": "input",
  141775. "Q": "output",
  141776. "R": "input"
  141777. },
  141778. "connections": {
  141779. "C": [ 42 ],
  141780. "D": [ 102 ],
  141781. "E": [ 5392 ],
  141782. "Q": [ 5873 ],
  141783. "R": [ 127 ]
  141784. }
  141785. },
  141786. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  141787. "hide_name": 0,
  141788. "type": "SB_DFF",
  141789. "parameters": {
  141790. },
  141791. "attributes": {
  141792. "BEL": " ",
  141793. "SERDES_ATTR": " ",
  141794. "SERDES_GRP": "00000000000000000010000000000010",
  141795. "dont_touch": "00000000000000000000000000000001",
  141796. "hdlname": "phy_I bit[2].osd_o_I genblk1[2].dff_cap_I genblk1.dff_I",
  141797. "keep": "00000000000000000000000000000001",
  141798. "module_not_derived": "00000000000000000000000000000001",
  141799. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  141800. },
  141801. "port_directions": {
  141802. "C": "input",
  141803. "D": "input",
  141804. "Q": "output"
  141805. },
  141806. "connections": {
  141807. "C": [ 42 ],
  141808. "D": [ 5804 ],
  141809. "Q": [ 5874 ]
  141810. }
  141811. },
  141812. "phy_I.bit[2].osd_o_I.genblk1[3].dff_cap_I.d_SB_DFF_Q": {
  141813. "hide_name": 0,
  141814. "type": "SB_DFF",
  141815. "parameters": {
  141816. },
  141817. "attributes": {
  141818. "module_not_derived": "00000000000000000000000000000001",
  141819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  141820. },
  141821. "port_directions": {
  141822. "C": "input",
  141823. "D": "input",
  141824. "Q": "output"
  141825. },
  141826. "connections": {
  141827. "C": [ 42 ],
  141828. "D": [ 5807 ],
  141829. "Q": [ 5688 ]
  141830. }
  141831. },
  141832. "phy_I.bit[2].osd_o_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  141833. "hide_name": 0,
  141834. "type": "SB_DFF",
  141835. "parameters": {
  141836. },
  141837. "attributes": {
  141838. "BEL": " ",
  141839. "SERDES_ATTR": " ",
  141840. "SERDES_GRP": "00000000000000000010000000000011",
  141841. "dont_touch": "00000000000000000000000000000001",
  141842. "hdlname": "phy_I bit[2].osd_o_I genblk1[3].dff_cap_I genblk1.dff_I",
  141843. "keep": "00000000000000000000000000000001",
  141844. "module_not_derived": "00000000000000000000000000000001",
  141845. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  141846. },
  141847. "port_directions": {
  141848. "C": "input",
  141849. "D": "input",
  141850. "Q": "output"
  141851. },
  141852. "connections": {
  141853. "C": [ 42 ],
  141854. "D": [ 5688 ],
  141855. "Q": [ 5875 ]
  141856. }
  141857. },
  141858. "phy_I.bit[2].osd_o_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  141859. "hide_name": 0,
  141860. "type": "SB_LUT4",
  141861. "parameters": {
  141862. "LUT_INIT": "1111000000000000"
  141863. },
  141864. "attributes": {
  141865. "module_not_derived": "00000000000000000000000000000001",
  141866. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  141867. },
  141868. "port_directions": {
  141869. "I0": "input",
  141870. "I1": "input",
  141871. "I2": "input",
  141872. "I3": "input",
  141873. "O": "output"
  141874. },
  141875. "connections": {
  141876. "I0": [ "0" ],
  141877. "I1": [ "0" ],
  141878. "I2": [ 5796 ],
  141879. "I3": [ 5672 ],
  141880. "O": [ 5876 ]
  141881. }
  141882. },
  141883. "phy_I.bit[2].osd_o_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  141884. "hide_name": 0,
  141885. "type": "SB_DFF",
  141886. "parameters": {
  141887. },
  141888. "attributes": {
  141889. "BEL": " ",
  141890. "SERDES_ATTR": " ",
  141891. "SERDES_GRP": "00000000000000000010000000010000",
  141892. "dont_touch": "00000000000000000000000000000001",
  141893. "hdlname": "phy_I bit[2].osd_o_I genblk2[0].dff_shift_I genblk1.dff_I",
  141894. "keep": "00000000000000000000000000000001",
  141895. "module_not_derived": "00000000000000000000000000000001",
  141896. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  141897. },
  141898. "port_directions": {
  141899. "C": "input",
  141900. "D": "input",
  141901. "Q": "output"
  141902. },
  141903. "connections": {
  141904. "C": [ 5666 ],
  141905. "D": [ 5876 ],
  141906. "Q": [ 5877 ]
  141907. }
  141908. },
  141909. "phy_I.bit[2].osd_o_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  141910. "hide_name": 0,
  141911. "type": "SB_LUT4",
  141912. "parameters": {
  141913. "LUT_INIT": "1111000011001100"
  141914. },
  141915. "attributes": {
  141916. "module_not_derived": "00000000000000000000000000000001",
  141917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  141918. },
  141919. "port_directions": {
  141920. "I0": "input",
  141921. "I1": "input",
  141922. "I2": "input",
  141923. "I3": "input",
  141924. "O": "output"
  141925. },
  141926. "connections": {
  141927. "I0": [ "0" ],
  141928. "I1": [ 5877 ],
  141929. "I2": [ 5802 ],
  141930. "I3": [ 5672 ],
  141931. "O": [ 5878 ]
  141932. }
  141933. },
  141934. "phy_I.bit[2].osd_o_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  141935. "hide_name": 0,
  141936. "type": "SB_DFF",
  141937. "parameters": {
  141938. },
  141939. "attributes": {
  141940. "BEL": " ",
  141941. "SERDES_ATTR": " ",
  141942. "SERDES_GRP": "00000000000000000010000000010001",
  141943. "dont_touch": "00000000000000000000000000000001",
  141944. "hdlname": "phy_I bit[2].osd_o_I genblk2[1].dff_shift_I genblk1.dff_I",
  141945. "keep": "00000000000000000000000000000001",
  141946. "module_not_derived": "00000000000000000000000000000001",
  141947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  141948. },
  141949. "port_directions": {
  141950. "C": "input",
  141951. "D": "input",
  141952. "Q": "output"
  141953. },
  141954. "connections": {
  141955. "C": [ 5666 ],
  141956. "D": [ 5878 ],
  141957. "Q": [ 5879 ]
  141958. }
  141959. },
  141960. "phy_I.bit[2].osd_o_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  141961. "hide_name": 0,
  141962. "type": "SB_LUT4",
  141963. "parameters": {
  141964. "LUT_INIT": "1111000011001100"
  141965. },
  141966. "attributes": {
  141967. "module_not_derived": "00000000000000000000000000000001",
  141968. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  141969. },
  141970. "port_directions": {
  141971. "I0": "input",
  141972. "I1": "input",
  141973. "I2": "input",
  141974. "I3": "input",
  141975. "O": "output"
  141976. },
  141977. "connections": {
  141978. "I0": [ "0" ],
  141979. "I1": [ 5879 ],
  141980. "I2": [ 5874 ],
  141981. "I3": [ 5672 ],
  141982. "O": [ 5880 ]
  141983. }
  141984. },
  141985. "phy_I.bit[2].osd_o_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  141986. "hide_name": 0,
  141987. "type": "SB_DFF",
  141988. "parameters": {
  141989. },
  141990. "attributes": {
  141991. "BEL": " ",
  141992. "SERDES_ATTR": " ",
  141993. "SERDES_GRP": "00000000000000000010000000010010",
  141994. "dont_touch": "00000000000000000000000000000001",
  141995. "hdlname": "phy_I bit[2].osd_o_I genblk2[2].dff_shift_I genblk1.dff_I",
  141996. "keep": "00000000000000000000000000000001",
  141997. "module_not_derived": "00000000000000000000000000000001",
  141998. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  141999. },
  142000. "port_directions": {
  142001. "C": "input",
  142002. "D": "input",
  142003. "Q": "output"
  142004. },
  142005. "connections": {
  142006. "C": [ 5666 ],
  142007. "D": [ 5880 ],
  142008. "Q": [ 5881 ]
  142009. }
  142010. },
  142011. "phy_I.bit[2].osd_o_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  142012. "hide_name": 0,
  142013. "type": "SB_LUT4",
  142014. "parameters": {
  142015. "LUT_INIT": "1111000011001100"
  142016. },
  142017. "attributes": {
  142018. "module_not_derived": "00000000000000000000000000000001",
  142019. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142020. },
  142021. "port_directions": {
  142022. "I0": "input",
  142023. "I1": "input",
  142024. "I2": "input",
  142025. "I3": "input",
  142026. "O": "output"
  142027. },
  142028. "connections": {
  142029. "I0": [ "0" ],
  142030. "I1": [ 5881 ],
  142031. "I2": [ 5875 ],
  142032. "I3": [ 5672 ],
  142033. "O": [ 5882 ]
  142034. }
  142035. },
  142036. "phy_I.bit[2].osd_o_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  142037. "hide_name": 0,
  142038. "type": "SB_DFF",
  142039. "parameters": {
  142040. },
  142041. "attributes": {
  142042. "BEL": " ",
  142043. "SERDES_ATTR": " ",
  142044. "SERDES_GRP": "00000000000000000010000000010011",
  142045. "dont_touch": "00000000000000000000000000000001",
  142046. "hdlname": "phy_I bit[2].osd_o_I genblk2[3].dff_shift_I genblk1.dff_I",
  142047. "keep": "00000000000000000000000000000001",
  142048. "module_not_derived": "00000000000000000000000000000001",
  142049. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142050. },
  142051. "port_directions": {
  142052. "C": "input",
  142053. "D": "input",
  142054. "Q": "output"
  142055. },
  142056. "connections": {
  142057. "C": [ 5666 ],
  142058. "D": [ 5882 ],
  142059. "Q": [ 5883 ]
  142060. }
  142061. },
  142062. "phy_I.bit[2].osd_oe_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  142063. "hide_name": 0,
  142064. "type": "SB_DFF",
  142065. "parameters": {
  142066. },
  142067. "attributes": {
  142068. "BEL": " ",
  142069. "SERDES_ATTR": " ",
  142070. "SERDES_GRP": "00000000000000000010001000000000",
  142071. "dont_touch": "00000000000000000000000000000001",
  142072. "hdlname": "phy_I bit[2].osd_oe_I genblk1[0].dff_cap_I genblk1.dff_I",
  142073. "keep": "00000000000000000000000000000001",
  142074. "module_not_derived": "00000000000000000000000000000001",
  142075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142076. },
  142077. "port_directions": {
  142078. "C": "input",
  142079. "D": "input",
  142080. "Q": "output"
  142081. },
  142082. "connections": {
  142083. "C": [ 42 ],
  142084. "D": [ 5612 ],
  142085. "Q": [ 5884 ]
  142086. }
  142087. },
  142088. "phy_I.bit[2].osd_oe_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  142089. "hide_name": 0,
  142090. "type": "SB_DFF",
  142091. "parameters": {
  142092. },
  142093. "attributes": {
  142094. "BEL": " ",
  142095. "SERDES_ATTR": " ",
  142096. "SERDES_GRP": "00000000000000000010001000000001",
  142097. "dont_touch": "00000000000000000000000000000001",
  142098. "hdlname": "phy_I bit[2].osd_oe_I genblk1[1].dff_cap_I genblk1.dff_I",
  142099. "keep": "00000000000000000000000000000001",
  142100. "module_not_derived": "00000000000000000000000000000001",
  142101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142102. },
  142103. "port_directions": {
  142104. "C": "input",
  142105. "D": "input",
  142106. "Q": "output"
  142107. },
  142108. "connections": {
  142109. "C": [ 42 ],
  142110. "D": [ 5612 ],
  142111. "Q": [ 5885 ]
  142112. }
  142113. },
  142114. "phy_I.bit[2].osd_oe_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  142115. "hide_name": 0,
  142116. "type": "SB_DFF",
  142117. "parameters": {
  142118. },
  142119. "attributes": {
  142120. "BEL": " ",
  142121. "SERDES_ATTR": " ",
  142122. "SERDES_GRP": "00000000000000000010001000000010",
  142123. "dont_touch": "00000000000000000000000000000001",
  142124. "hdlname": "phy_I bit[2].osd_oe_I genblk1[2].dff_cap_I genblk1.dff_I",
  142125. "keep": "00000000000000000000000000000001",
  142126. "module_not_derived": "00000000000000000000000000000001",
  142127. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142128. },
  142129. "port_directions": {
  142130. "C": "input",
  142131. "D": "input",
  142132. "Q": "output"
  142133. },
  142134. "connections": {
  142135. "C": [ 42 ],
  142136. "D": [ 5612 ],
  142137. "Q": [ 5886 ]
  142138. }
  142139. },
  142140. "phy_I.bit[2].osd_oe_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  142141. "hide_name": 0,
  142142. "type": "SB_DFF",
  142143. "parameters": {
  142144. },
  142145. "attributes": {
  142146. "BEL": " ",
  142147. "SERDES_ATTR": " ",
  142148. "SERDES_GRP": "00000000000000000010001000000011",
  142149. "dont_touch": "00000000000000000000000000000001",
  142150. "hdlname": "phy_I bit[2].osd_oe_I genblk1[3].dff_cap_I genblk1.dff_I",
  142151. "keep": "00000000000000000000000000000001",
  142152. "module_not_derived": "00000000000000000000000000000001",
  142153. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142154. },
  142155. "port_directions": {
  142156. "C": "input",
  142157. "D": "input",
  142158. "Q": "output"
  142159. },
  142160. "connections": {
  142161. "C": [ 42 ],
  142162. "D": [ 5612 ],
  142163. "Q": [ 5887 ]
  142164. }
  142165. },
  142166. "phy_I.bit[2].osd_oe_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  142167. "hide_name": 0,
  142168. "type": "SB_LUT4",
  142169. "parameters": {
  142170. "LUT_INIT": "1111000000000000"
  142171. },
  142172. "attributes": {
  142173. "module_not_derived": "00000000000000000000000000000001",
  142174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  142175. },
  142176. "port_directions": {
  142177. "I0": "input",
  142178. "I1": "input",
  142179. "I2": "input",
  142180. "I3": "input",
  142181. "O": "output"
  142182. },
  142183. "connections": {
  142184. "I0": [ "0" ],
  142185. "I1": [ "0" ],
  142186. "I2": [ 5884 ],
  142187. "I3": [ 5672 ],
  142188. "O": [ 5888 ]
  142189. }
  142190. },
  142191. "phy_I.bit[2].osd_oe_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  142192. "hide_name": 0,
  142193. "type": "SB_DFF",
  142194. "parameters": {
  142195. },
  142196. "attributes": {
  142197. "BEL": " ",
  142198. "SERDES_ATTR": " ",
  142199. "SERDES_GRP": "00000000000000000010001000010000",
  142200. "dont_touch": "00000000000000000000000000000001",
  142201. "hdlname": "phy_I bit[2].osd_oe_I genblk2[0].dff_shift_I genblk1.dff_I",
  142202. "keep": "00000000000000000000000000000001",
  142203. "module_not_derived": "00000000000000000000000000000001",
  142204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142205. },
  142206. "port_directions": {
  142207. "C": "input",
  142208. "D": "input",
  142209. "Q": "output"
  142210. },
  142211. "connections": {
  142212. "C": [ 5666 ],
  142213. "D": [ 5888 ],
  142214. "Q": [ 5889 ]
  142215. }
  142216. },
  142217. "phy_I.bit[2].osd_oe_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  142218. "hide_name": 0,
  142219. "type": "SB_LUT4",
  142220. "parameters": {
  142221. "LUT_INIT": "1111000011001100"
  142222. },
  142223. "attributes": {
  142224. "module_not_derived": "00000000000000000000000000000001",
  142225. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142226. },
  142227. "port_directions": {
  142228. "I0": "input",
  142229. "I1": "input",
  142230. "I2": "input",
  142231. "I3": "input",
  142232. "O": "output"
  142233. },
  142234. "connections": {
  142235. "I0": [ "0" ],
  142236. "I1": [ 5889 ],
  142237. "I2": [ 5885 ],
  142238. "I3": [ 5672 ],
  142239. "O": [ 5890 ]
  142240. }
  142241. },
  142242. "phy_I.bit[2].osd_oe_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  142243. "hide_name": 0,
  142244. "type": "SB_DFF",
  142245. "parameters": {
  142246. },
  142247. "attributes": {
  142248. "BEL": " ",
  142249. "SERDES_ATTR": " ",
  142250. "SERDES_GRP": "00000000000000000010001000010001",
  142251. "dont_touch": "00000000000000000000000000000001",
  142252. "hdlname": "phy_I bit[2].osd_oe_I genblk2[1].dff_shift_I genblk1.dff_I",
  142253. "keep": "00000000000000000000000000000001",
  142254. "module_not_derived": "00000000000000000000000000000001",
  142255. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142256. },
  142257. "port_directions": {
  142258. "C": "input",
  142259. "D": "input",
  142260. "Q": "output"
  142261. },
  142262. "connections": {
  142263. "C": [ 5666 ],
  142264. "D": [ 5890 ],
  142265. "Q": [ 5891 ]
  142266. }
  142267. },
  142268. "phy_I.bit[2].osd_oe_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  142269. "hide_name": 0,
  142270. "type": "SB_LUT4",
  142271. "parameters": {
  142272. "LUT_INIT": "1111000011001100"
  142273. },
  142274. "attributes": {
  142275. "module_not_derived": "00000000000000000000000000000001",
  142276. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142277. },
  142278. "port_directions": {
  142279. "I0": "input",
  142280. "I1": "input",
  142281. "I2": "input",
  142282. "I3": "input",
  142283. "O": "output"
  142284. },
  142285. "connections": {
  142286. "I0": [ "0" ],
  142287. "I1": [ 5891 ],
  142288. "I2": [ 5886 ],
  142289. "I3": [ 5672 ],
  142290. "O": [ 5892 ]
  142291. }
  142292. },
  142293. "phy_I.bit[2].osd_oe_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  142294. "hide_name": 0,
  142295. "type": "SB_DFF",
  142296. "parameters": {
  142297. },
  142298. "attributes": {
  142299. "BEL": " ",
  142300. "SERDES_ATTR": " ",
  142301. "SERDES_GRP": "00000000000000000010001000010010",
  142302. "dont_touch": "00000000000000000000000000000001",
  142303. "hdlname": "phy_I bit[2].osd_oe_I genblk2[2].dff_shift_I genblk1.dff_I",
  142304. "keep": "00000000000000000000000000000001",
  142305. "module_not_derived": "00000000000000000000000000000001",
  142306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142307. },
  142308. "port_directions": {
  142309. "C": "input",
  142310. "D": "input",
  142311. "Q": "output"
  142312. },
  142313. "connections": {
  142314. "C": [ 5666 ],
  142315. "D": [ 5892 ],
  142316. "Q": [ 5893 ]
  142317. }
  142318. },
  142319. "phy_I.bit[2].osd_oe_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  142320. "hide_name": 0,
  142321. "type": "SB_LUT4",
  142322. "parameters": {
  142323. "LUT_INIT": "1111000011001100"
  142324. },
  142325. "attributes": {
  142326. "module_not_derived": "00000000000000000000000000000001",
  142327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142328. },
  142329. "port_directions": {
  142330. "I0": "input",
  142331. "I1": "input",
  142332. "I2": "input",
  142333. "I3": "input",
  142334. "O": "output"
  142335. },
  142336. "connections": {
  142337. "I0": [ "0" ],
  142338. "I1": [ 5893 ],
  142339. "I2": [ 5887 ],
  142340. "I3": [ 5672 ],
  142341. "O": [ 5894 ]
  142342. }
  142343. },
  142344. "phy_I.bit[2].osd_oe_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  142345. "hide_name": 0,
  142346. "type": "SB_DFF",
  142347. "parameters": {
  142348. },
  142349. "attributes": {
  142350. "BEL": " ",
  142351. "SERDES_ATTR": " ",
  142352. "SERDES_GRP": "00000000000000000010001000010011",
  142353. "dont_touch": "00000000000000000000000000000001",
  142354. "hdlname": "phy_I bit[2].osd_oe_I genblk2[3].dff_shift_I genblk1.dff_I",
  142355. "keep": "00000000000000000000000000000001",
  142356. "module_not_derived": "00000000000000000000000000000001",
  142357. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142358. },
  142359. "port_directions": {
  142360. "C": "input",
  142361. "D": "input",
  142362. "Q": "output"
  142363. },
  142364. "connections": {
  142365. "C": [ 5666 ],
  142366. "D": [ 5894 ],
  142367. "Q": [ 5895 ]
  142368. }
  142369. },
  142370. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.genblk1.dff_I": {
  142371. "hide_name": 0,
  142372. "type": "SB_DFF",
  142373. "parameters": {
  142374. },
  142375. "attributes": {
  142376. "BEL": " ",
  142377. "SERDES_ATTR": " ",
  142378. "SERDES_GRP": "00000000000000000011010010100000",
  142379. "dont_touch": "00000000000000000000000000000001",
  142380. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[0].dff_shift_I genblk1.dff_I",
  142381. "keep": "00000000000000000000000000000001",
  142382. "module_not_derived": "00000000000000000000000000000001",
  142383. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142384. },
  142385. "port_directions": {
  142386. "C": "input",
  142387. "D": "input",
  142388. "Q": "output"
  142389. },
  142390. "connections": {
  142391. "C": [ 5666 ],
  142392. "D": [ 5896 ],
  142393. "Q": [ 5897 ]
  142394. }
  142395. },
  142396. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.genblk1.dff_I": {
  142397. "hide_name": 0,
  142398. "type": "SB_DFF",
  142399. "parameters": {
  142400. },
  142401. "attributes": {
  142402. "BEL": " ",
  142403. "SERDES_ATTR": " ",
  142404. "SERDES_GRP": "00000000000000000011010010100001",
  142405. "dont_touch": "00000000000000000000000000000001",
  142406. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[1].dff_shift_I genblk1.dff_I",
  142407. "keep": "00000000000000000000000000000001",
  142408. "module_not_derived": "00000000000000000000000000000001",
  142409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142410. },
  142411. "port_directions": {
  142412. "C": "input",
  142413. "D": "input",
  142414. "Q": "output"
  142415. },
  142416. "connections": {
  142417. "C": [ 5666 ],
  142418. "D": [ 5897 ],
  142419. "Q": [ 5898 ]
  142420. }
  142421. },
  142422. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.genblk1.dff_I": {
  142423. "hide_name": 0,
  142424. "type": "SB_DFF",
  142425. "parameters": {
  142426. },
  142427. "attributes": {
  142428. "BEL": " ",
  142429. "SERDES_ATTR": " ",
  142430. "SERDES_GRP": "00000000000000000011010010100010",
  142431. "dont_touch": "00000000000000000000000000000001",
  142432. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[2].dff_shift_I genblk1.dff_I",
  142433. "keep": "00000000000000000000000000000001",
  142434. "module_not_derived": "00000000000000000000000000000001",
  142435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142436. },
  142437. "port_directions": {
  142438. "C": "input",
  142439. "D": "input",
  142440. "Q": "output"
  142441. },
  142442. "connections": {
  142443. "C": [ 5666 ],
  142444. "D": [ 5898 ],
  142445. "Q": [ 5899 ]
  142446. }
  142447. },
  142448. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.genblk1.dff_I": {
  142449. "hide_name": 0,
  142450. "type": "SB_DFF",
  142451. "parameters": {
  142452. },
  142453. "attributes": {
  142454. "BEL": " ",
  142455. "SERDES_ATTR": " ",
  142456. "SERDES_GRP": "00000000000000000011010010100011",
  142457. "dont_touch": "00000000000000000000000000000001",
  142458. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[3].dff_shift_I genblk1.dff_I",
  142459. "keep": "00000000000000000000000000000001",
  142460. "module_not_derived": "00000000000000000000000000000001",
  142461. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142462. },
  142463. "port_directions": {
  142464. "C": "input",
  142465. "D": "input",
  142466. "Q": "output"
  142467. },
  142468. "connections": {
  142469. "C": [ 5666 ],
  142470. "D": [ 5899 ],
  142471. "Q": [ 5900 ]
  142472. }
  142473. },
  142474. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  142475. "hide_name": 0,
  142476. "type": "SB_DFFE",
  142477. "parameters": {
  142478. },
  142479. "attributes": {
  142480. "BEL": " ",
  142481. "SERDES_ATTR": " ",
  142482. "SERDES_GRP": "00000000000000000011010010010000",
  142483. "dont_touch": "00000000000000000000000000000001",
  142484. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[0].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  142485. "keep": "00000000000000000000000000000001",
  142486. "module_not_derived": "00000000000000000000000000000001",
  142487. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  142488. },
  142489. "port_directions": {
  142490. "C": "input",
  142491. "D": "input",
  142492. "E": "input",
  142493. "Q": "output"
  142494. },
  142495. "connections": {
  142496. "C": [ 5666 ],
  142497. "D": [ 5897 ],
  142498. "E": [ 5672 ],
  142499. "Q": [ 5901 ]
  142500. }
  142501. },
  142502. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  142503. "hide_name": 0,
  142504. "type": "SB_DFFE",
  142505. "parameters": {
  142506. },
  142507. "attributes": {
  142508. "BEL": " ",
  142509. "SERDES_ATTR": " ",
  142510. "SERDES_GRP": "00000000000000000011010010010001",
  142511. "dont_touch": "00000000000000000000000000000001",
  142512. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[1].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  142513. "keep": "00000000000000000000000000000001",
  142514. "module_not_derived": "00000000000000000000000000000001",
  142515. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  142516. },
  142517. "port_directions": {
  142518. "C": "input",
  142519. "D": "input",
  142520. "E": "input",
  142521. "Q": "output"
  142522. },
  142523. "connections": {
  142524. "C": [ 5666 ],
  142525. "D": [ 5898 ],
  142526. "E": [ 5672 ],
  142527. "Q": [ 5902 ]
  142528. }
  142529. },
  142530. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  142531. "hide_name": 0,
  142532. "type": "SB_DFFE",
  142533. "parameters": {
  142534. },
  142535. "attributes": {
  142536. "BEL": " ",
  142537. "SERDES_ATTR": " ",
  142538. "SERDES_GRP": "00000000000000000011010010010010",
  142539. "dont_touch": "00000000000000000000000000000001",
  142540. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[2].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  142541. "keep": "00000000000000000000000000000001",
  142542. "module_not_derived": "00000000000000000000000000000001",
  142543. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  142544. },
  142545. "port_directions": {
  142546. "C": "input",
  142547. "D": "input",
  142548. "E": "input",
  142549. "Q": "output"
  142550. },
  142551. "connections": {
  142552. "C": [ 5666 ],
  142553. "D": [ 5899 ],
  142554. "E": [ 5672 ],
  142555. "Q": [ 5903 ]
  142556. }
  142557. },
  142558. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.genblk1.genblk1.genblk1.dff_I": {
  142559. "hide_name": 0,
  142560. "type": "SB_DFFE",
  142561. "parameters": {
  142562. },
  142563. "attributes": {
  142564. "BEL": " ",
  142565. "SERDES_ATTR": " ",
  142566. "SERDES_GRP": "00000000000000000011010010010011",
  142567. "dont_touch": "00000000000000000000000000000001",
  142568. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[3].dff_shift_I genblk1.genblk1.genblk1.dff_I",
  142569. "keep": "00000000000000000000000000000001",
  142570. "module_not_derived": "00000000000000000000000000000001",
  142571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:50.12-55.5"
  142572. },
  142573. "port_directions": {
  142574. "C": "input",
  142575. "D": "input",
  142576. "E": "input",
  142577. "Q": "output"
  142578. },
  142579. "connections": {
  142580. "C": [ 5666 ],
  142581. "D": [ 5900 ],
  142582. "E": [ 5672 ],
  142583. "Q": [ 5904 ]
  142584. }
  142585. },
  142586. "phy_I.bit[3].isd_I.genblk2.genblk2[0].dff_scap_I.genblk1.dff_I": {
  142587. "hide_name": 0,
  142588. "type": "SB_DFF",
  142589. "parameters": {
  142590. },
  142591. "attributes": {
  142592. "BEL": " ",
  142593. "SERDES_ATTR": " ",
  142594. "SERDES_GRP": "00000000000000000011011010000000",
  142595. "dont_touch": "00000000000000000000000000000001",
  142596. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[0].dff_scap_I genblk1.dff_I",
  142597. "keep": "00000000000000000000000000000001",
  142598. "module_not_derived": "00000000000000000000000000000001",
  142599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142600. },
  142601. "port_directions": {
  142602. "C": "input",
  142603. "D": "input",
  142604. "Q": "output"
  142605. },
  142606. "connections": {
  142607. "C": [ 42 ],
  142608. "D": [ 5901 ],
  142609. "Q": [ 5905 ]
  142610. }
  142611. },
  142612. "phy_I.bit[3].isd_I.genblk2.genblk2[1].dff_scap_I.genblk1.dff_I": {
  142613. "hide_name": 0,
  142614. "type": "SB_DFF",
  142615. "parameters": {
  142616. },
  142617. "attributes": {
  142618. "BEL": " ",
  142619. "SERDES_ATTR": " ",
  142620. "SERDES_GRP": "00000000000000000011011010000001",
  142621. "dont_touch": "00000000000000000000000000000001",
  142622. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[1].dff_scap_I genblk1.dff_I",
  142623. "keep": "00000000000000000000000000000001",
  142624. "module_not_derived": "00000000000000000000000000000001",
  142625. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142626. },
  142627. "port_directions": {
  142628. "C": "input",
  142629. "D": "input",
  142630. "Q": "output"
  142631. },
  142632. "connections": {
  142633. "C": [ 42 ],
  142634. "D": [ 5902 ],
  142635. "Q": [ 5906 ]
  142636. }
  142637. },
  142638. "phy_I.bit[3].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I1": {
  142639. "hide_name": 0,
  142640. "type": "SB_LUT4",
  142641. "parameters": {
  142642. "LUT_INIT": "1100110011110000"
  142643. },
  142644. "attributes": {
  142645. "module_not_derived": "00000000000000000000000000000001",
  142646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142647. },
  142648. "port_directions": {
  142649. "I0": "input",
  142650. "I1": "input",
  142651. "I2": "input",
  142652. "I3": "input",
  142653. "O": "output"
  142654. },
  142655. "connections": {
  142656. "I0": [ "0" ],
  142657. "I1": [ 5906 ],
  142658. "I2": [ 5727 ],
  142659. "I3": [ 5409 ],
  142660. "O": [ 5537 ]
  142661. }
  142662. },
  142663. "phy_I.bit[3].isd_I.genblk2.genblk2[2].dff_scap_I.genblk1.dff_I": {
  142664. "hide_name": 0,
  142665. "type": "SB_DFF",
  142666. "parameters": {
  142667. },
  142668. "attributes": {
  142669. "BEL": " ",
  142670. "SERDES_ATTR": " ",
  142671. "SERDES_GRP": "00000000000000000011011010000010",
  142672. "dont_touch": "00000000000000000000000000000001",
  142673. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[2].dff_scap_I genblk1.dff_I",
  142674. "keep": "00000000000000000000000000000001",
  142675. "module_not_derived": "00000000000000000000000000000001",
  142676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142677. },
  142678. "port_directions": {
  142679. "C": "input",
  142680. "D": "input",
  142681. "Q": "output"
  142682. },
  142683. "connections": {
  142684. "C": [ 42 ],
  142685. "D": [ 5903 ],
  142686. "Q": [ 5907 ]
  142687. }
  142688. },
  142689. "phy_I.bit[3].isd_I.genblk2.genblk2[2].dff_scap_I.q_SB_LUT4_I2": {
  142690. "hide_name": 0,
  142691. "type": "SB_LUT4",
  142692. "parameters": {
  142693. "LUT_INIT": "1111000011001100"
  142694. },
  142695. "attributes": {
  142696. "module_not_derived": "00000000000000000000000000000001",
  142697. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142698. },
  142699. "port_directions": {
  142700. "I0": "input",
  142701. "I1": "input",
  142702. "I2": "input",
  142703. "I3": "input",
  142704. "O": "output"
  142705. },
  142706. "connections": {
  142707. "I0": [ "0" ],
  142708. "I1": [ 225 ],
  142709. "I2": [ 5907 ],
  142710. "I3": [ 5409 ],
  142711. "O": [ 5533 ]
  142712. }
  142713. },
  142714. "phy_I.bit[3].isd_I.genblk2.genblk2[3].dff_scap_I.genblk1.dff_I": {
  142715. "hide_name": 0,
  142716. "type": "SB_DFF",
  142717. "parameters": {
  142718. },
  142719. "attributes": {
  142720. "BEL": " ",
  142721. "SERDES_ATTR": " ",
  142722. "SERDES_GRP": "00000000000000000011011010000011",
  142723. "dont_touch": "00000000000000000000000000000001",
  142724. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[3].dff_scap_I genblk1.dff_I",
  142725. "keep": "00000000000000000000000000000001",
  142726. "module_not_derived": "00000000000000000000000000000001",
  142727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142728. },
  142729. "port_directions": {
  142730. "C": "input",
  142731. "D": "input",
  142732. "Q": "output"
  142733. },
  142734. "connections": {
  142735. "C": [ 42 ],
  142736. "D": [ 5904 ],
  142737. "Q": [ 5908 ]
  142738. }
  142739. },
  142740. "phy_I.bit[3].isd_I.genblk2.genblk2[3].dff_scap_I.q_SB_LUT4_I2": {
  142741. "hide_name": 0,
  142742. "type": "SB_LUT4",
  142743. "parameters": {
  142744. "LUT_INIT": "1111000011001100"
  142745. },
  142746. "attributes": {
  142747. "module_not_derived": "00000000000000000000000000000001",
  142748. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142749. },
  142750. "port_directions": {
  142751. "I0": "input",
  142752. "I1": "input",
  142753. "I2": "input",
  142754. "I3": "input",
  142755. "O": "output"
  142756. },
  142757. "connections": {
  142758. "I0": [ "0" ],
  142759. "I1": [ 280 ],
  142760. "I2": [ 5908 ],
  142761. "I3": [ 5409 ],
  142762. "O": [ 5529 ]
  142763. }
  142764. },
  142765. "phy_I.bit[3].isd_I.genblk2.genblk2[4].dff_scap_I.genblk1.dff_I": {
  142766. "hide_name": 0,
  142767. "type": "SB_DFF",
  142768. "parameters": {
  142769. },
  142770. "attributes": {
  142771. "BEL": " ",
  142772. "SERDES_ATTR": " ",
  142773. "SERDES_GRP": "00000000000000000011011010000100",
  142774. "dont_touch": "00000000000000000000000000000001",
  142775. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[4].dff_scap_I genblk1.dff_I",
  142776. "keep": "00000000000000000000000000000001",
  142777. "module_not_derived": "00000000000000000000000000000001",
  142778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142779. },
  142780. "port_directions": {
  142781. "C": "input",
  142782. "D": "input",
  142783. "Q": "output"
  142784. },
  142785. "connections": {
  142786. "C": [ 42 ],
  142787. "D": [ 5905 ],
  142788. "Q": [ 5909 ]
  142789. }
  142790. },
  142791. "phy_I.bit[3].isd_I.genblk2.genblk2[4].dff_scap_I.q_SB_LUT4_I2": {
  142792. "hide_name": 0,
  142793. "type": "SB_LUT4",
  142794. "parameters": {
  142795. "LUT_INIT": "1111000011001100"
  142796. },
  142797. "attributes": {
  142798. "module_not_derived": "00000000000000000000000000000001",
  142799. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  142800. },
  142801. "port_directions": {
  142802. "I0": "input",
  142803. "I1": "input",
  142804. "I2": "input",
  142805. "I3": "input",
  142806. "O": "output"
  142807. },
  142808. "connections": {
  142809. "I0": [ "0" ],
  142810. "I1": [ 219 ],
  142811. "I2": [ 5909 ],
  142812. "I3": [ 5409 ],
  142813. "O": [ 5524 ]
  142814. }
  142815. },
  142816. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_DFF_Q": {
  142817. "hide_name": 0,
  142818. "type": "SB_DFF",
  142819. "parameters": {
  142820. },
  142821. "attributes": {
  142822. "module_not_derived": "00000000000000000000000000000001",
  142823. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  142824. },
  142825. "port_directions": {
  142826. "C": "input",
  142827. "D": "input",
  142828. "Q": "output"
  142829. },
  142830. "connections": {
  142831. "C": [ 42 ],
  142832. "D": [ 5839 ],
  142833. "Q": [ 5910 ]
  142834. }
  142835. },
  142836. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1": {
  142837. "hide_name": 0,
  142838. "type": "SB_LUT4",
  142839. "parameters": {
  142840. "LUT_INIT": "0001010100111111"
  142841. },
  142842. "attributes": {
  142843. "module_not_derived": "00000000000000000000000000000001",
  142844. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  142845. },
  142846. "port_directions": {
  142847. "I0": "input",
  142848. "I1": "input",
  142849. "I2": "input",
  142850. "I3": "input",
  142851. "O": "output"
  142852. },
  142853. "connections": {
  142854. "I0": [ 256 ],
  142855. "I1": [ 5910 ],
  142856. "I2": [ 5622 ],
  142857. "I3": [ 122 ],
  142858. "O": [ 5846 ]
  142859. }
  142860. },
  142861. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O": {
  142862. "hide_name": 0,
  142863. "type": "SB_LUT4",
  142864. "parameters": {
  142865. "LUT_INIT": "0001001101011111"
  142866. },
  142867. "attributes": {
  142868. "module_not_derived": "00000000000000000000000000000001",
  142869. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  142870. },
  142871. "port_directions": {
  142872. "I0": "input",
  142873. "I1": "input",
  142874. "I2": "input",
  142875. "I3": "input",
  142876. "O": "output"
  142877. },
  142878. "connections": {
  142879. "I0": [ 5578 ],
  142880. "I1": [ 5911 ],
  142881. "I2": [ 5613 ],
  142882. "I3": [ 5418 ],
  142883. "O": [ 5847 ]
  142884. }
  142885. },
  142886. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_1": {
  142887. "hide_name": 0,
  142888. "type": "SB_LUT4",
  142889. "parameters": {
  142890. "LUT_INIT": "1100101000000000"
  142891. },
  142892. "attributes": {
  142893. "module_not_derived": "00000000000000000000000000000001",
  142894. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  142895. },
  142896. "port_directions": {
  142897. "I0": "input",
  142898. "I1": "input",
  142899. "I2": "input",
  142900. "I3": "input",
  142901. "O": "output"
  142902. },
  142903. "connections": {
  142904. "I0": [ 482 ],
  142905. "I1": [ 366 ],
  142906. "I2": [ 647 ],
  142907. "I3": [ 5419 ],
  142908. "O": [ 5845 ]
  142909. }
  142910. },
  142911. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  142912. "hide_name": 0,
  142913. "type": "SB_DFFER",
  142914. "parameters": {
  142915. },
  142916. "attributes": {
  142917. "module_not_derived": "00000000000000000000000000000001",
  142918. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  142919. },
  142920. "port_directions": {
  142921. "C": "input",
  142922. "D": "input",
  142923. "E": "input",
  142924. "Q": "output",
  142925. "R": "input"
  142926. },
  142927. "connections": {
  142928. "C": [ 42 ],
  142929. "D": [ 109 ],
  142930. "E": [ 5392 ],
  142931. "Q": [ 5911 ],
  142932. "R": [ 127 ]
  142933. }
  142934. },
  142935. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  142936. "hide_name": 0,
  142937. "type": "SB_DFF",
  142938. "parameters": {
  142939. },
  142940. "attributes": {
  142941. "BEL": " ",
  142942. "SERDES_ATTR": " ",
  142943. "SERDES_GRP": "00000000000000000011000000000000",
  142944. "dont_touch": "00000000000000000000000000000001",
  142945. "hdlname": "phy_I bit[3].osd_o_I genblk1[0].dff_cap_I genblk1.dff_I",
  142946. "keep": "00000000000000000000000000000001",
  142947. "module_not_derived": "00000000000000000000000000000001",
  142948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  142949. },
  142950. "port_directions": {
  142951. "C": "input",
  142952. "D": "input",
  142953. "Q": "output"
  142954. },
  142955. "connections": {
  142956. "C": [ 42 ],
  142957. "D": [ 5910 ],
  142958. "Q": [ 5912 ]
  142959. }
  142960. },
  142961. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_DFF_Q": {
  142962. "hide_name": 0,
  142963. "type": "SB_DFF",
  142964. "parameters": {
  142965. },
  142966. "attributes": {
  142967. "module_not_derived": "00000000000000000000000000000001",
  142968. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  142969. },
  142970. "port_directions": {
  142971. "C": "input",
  142972. "D": "input",
  142973. "Q": "output"
  142974. },
  142975. "connections": {
  142976. "C": [ 42 ],
  142977. "D": [ 5848 ],
  142978. "Q": [ 5913 ]
  142979. }
  142980. },
  142981. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0": {
  142982. "hide_name": 0,
  142983. "type": "SB_LUT4",
  142984. "parameters": {
  142985. "LUT_INIT": "0001001101011111"
  142986. },
  142987. "attributes": {
  142988. "module_not_derived": "00000000000000000000000000000001",
  142989. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  142990. },
  142991. "port_directions": {
  142992. "I0": "input",
  142993. "I1": "input",
  142994. "I2": "input",
  142995. "I3": "input",
  142996. "O": "output"
  142997. },
  142998. "connections": {
  142999. "I0": [ 5913 ],
  143000. "I1": [ 5914 ],
  143001. "I2": [ 5622 ],
  143002. "I3": [ 5418 ],
  143003. "O": [ 5915 ]
  143004. }
  143005. },
  143006. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_I1_SB_DFFER_Q": {
  143007. "hide_name": 0,
  143008. "type": "SB_DFFER",
  143009. "parameters": {
  143010. },
  143011. "attributes": {
  143012. "module_not_derived": "00000000000000000000000000000001",
  143013. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  143014. },
  143015. "port_directions": {
  143016. "C": "input",
  143017. "D": "input",
  143018. "E": "input",
  143019. "Q": "output",
  143020. "R": "input"
  143021. },
  143022. "connections": {
  143023. "C": [ 42 ],
  143024. "D": [ 108 ],
  143025. "E": [ 5392 ],
  143026. "Q": [ 5914 ],
  143027. "R": [ 127 ]
  143028. }
  143029. },
  143030. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1": {
  143031. "hide_name": 0,
  143032. "type": "SB_LUT4",
  143033. "parameters": {
  143034. "LUT_INIT": "1111111100111111"
  143035. },
  143036. "attributes": {
  143037. "module_not_derived": "00000000000000000000000000000001",
  143038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143039. },
  143040. "port_directions": {
  143041. "I0": "input",
  143042. "I1": "input",
  143043. "I2": "input",
  143044. "I3": "input",
  143045. "O": "output"
  143046. },
  143047. "connections": {
  143048. "I0": [ "0" ],
  143049. "I1": [ 5915 ],
  143050. "I2": [ 5916 ],
  143051. "I3": [ 5741 ],
  143052. "O": [ 5917 ]
  143053. }
  143054. },
  143055. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  143056. "hide_name": 0,
  143057. "type": "SB_LUT4",
  143058. "parameters": {
  143059. "LUT_INIT": "0001010100111111"
  143060. },
  143061. "attributes": {
  143062. "module_not_derived": "00000000000000000000000000000001",
  143063. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143064. },
  143065. "port_directions": {
  143066. "I0": "input",
  143067. "I1": "input",
  143068. "I2": "input",
  143069. "I3": "input",
  143070. "O": "output"
  143071. },
  143072. "connections": {
  143073. "I0": [ 183 ],
  143074. "I1": [ 5606 ],
  143075. "I2": [ 5613 ],
  143076. "I3": [ 122 ],
  143077. "O": [ 5916 ]
  143078. }
  143079. },
  143080. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  143081. "hide_name": 0,
  143082. "type": "SB_DFF",
  143083. "parameters": {
  143084. },
  143085. "attributes": {
  143086. "BEL": " ",
  143087. "SERDES_ATTR": " ",
  143088. "SERDES_GRP": "00000000000000000011000000000001",
  143089. "dont_touch": "00000000000000000000000000000001",
  143090. "hdlname": "phy_I bit[3].osd_o_I genblk1[1].dff_cap_I genblk1.dff_I",
  143091. "keep": "00000000000000000000000000000001",
  143092. "module_not_derived": "00000000000000000000000000000001",
  143093. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143094. },
  143095. "port_directions": {
  143096. "C": "input",
  143097. "D": "input",
  143098. "Q": "output"
  143099. },
  143100. "connections": {
  143101. "C": [ 42 ],
  143102. "D": [ 5913 ],
  143103. "Q": [ 5918 ]
  143104. }
  143105. },
  143106. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_DFF_Q": {
  143107. "hide_name": 0,
  143108. "type": "SB_DFF",
  143109. "parameters": {
  143110. },
  143111. "attributes": {
  143112. "module_not_derived": "00000000000000000000000000000001",
  143113. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  143114. },
  143115. "port_directions": {
  143116. "C": "input",
  143117. "D": "input",
  143118. "Q": "output"
  143119. },
  143120. "connections": {
  143121. "C": [ 42 ],
  143122. "D": [ 5917 ],
  143123. "Q": [ 5919 ]
  143124. }
  143125. },
  143126. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0": {
  143127. "hide_name": 0,
  143128. "type": "SB_LUT4",
  143129. "parameters": {
  143130. "LUT_INIT": "1111111100110101"
  143131. },
  143132. "attributes": {
  143133. "module_not_derived": "00000000000000000000000000000001",
  143134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143135. },
  143136. "port_directions": {
  143137. "I0": "input",
  143138. "I1": "input",
  143139. "I2": "input",
  143140. "I3": "input",
  143141. "O": "output"
  143142. },
  143143. "connections": {
  143144. "I0": [ 5919 ],
  143145. "I1": [ 5598 ],
  143146. "I2": [ 5551 ],
  143147. "I3": [ 5390 ],
  143148. "O": [ 5852 ]
  143149. }
  143150. },
  143151. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O": {
  143152. "hide_name": 0,
  143153. "type": "SB_LUT4",
  143154. "parameters": {
  143155. "LUT_INIT": "0001010100111111"
  143156. },
  143157. "attributes": {
  143158. "module_not_derived": "00000000000000000000000000000001",
  143159. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143160. },
  143161. "port_directions": {
  143162. "I0": "input",
  143163. "I1": "input",
  143164. "I2": "input",
  143165. "I3": "input",
  143166. "O": "output"
  143167. },
  143168. "connections": {
  143169. "I0": [ 252 ],
  143170. "I1": [ 5920 ],
  143171. "I2": [ 5418 ],
  143172. "I3": [ 122 ],
  143173. "O": [ 5853 ]
  143174. }
  143175. },
  143176. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1": {
  143177. "hide_name": 0,
  143178. "type": "SB_LUT4",
  143179. "parameters": {
  143180. "LUT_INIT": "0010000000000000"
  143181. },
  143182. "attributes": {
  143183. "module_not_derived": "00000000000000000000000000000001",
  143184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143185. },
  143186. "port_directions": {
  143187. "I0": "input",
  143188. "I1": "input",
  143189. "I2": "input",
  143190. "I3": "input",
  143191. "O": "output"
  143192. },
  143193. "connections": {
  143194. "I0": [ 123 ],
  143195. "I1": [ 124 ],
  143196. "I2": [ 5419 ],
  143197. "I3": [ 5484 ],
  143198. "O": [ 5750 ]
  143199. }
  143200. },
  143201. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O": {
  143202. "hide_name": 0,
  143203. "type": "SB_LUT4",
  143204. "parameters": {
  143205. "LUT_INIT": "0000000011110000"
  143206. },
  143207. "attributes": {
  143208. "module_not_derived": "00000000000000000000000000000001",
  143209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143210. },
  143211. "port_directions": {
  143212. "I0": "input",
  143213. "I1": "input",
  143214. "I2": "input",
  143215. "I3": "input",
  143216. "O": "output"
  143217. },
  143218. "connections": {
  143219. "I0": [ "0" ],
  143220. "I1": [ "0" ],
  143221. "I2": [ 5921 ],
  143222. "I3": [ 5922 ],
  143223. "O": [ 5484 ]
  143224. }
  143225. },
  143226. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_I3": {
  143227. "hide_name": 0,
  143228. "type": "SB_LUT4",
  143229. "parameters": {
  143230. "LUT_INIT": "1111000000000000"
  143231. },
  143232. "attributes": {
  143233. "module_not_derived": "00000000000000000000000000000001",
  143234. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  143235. },
  143236. "port_directions": {
  143237. "I0": "input",
  143238. "I1": "input",
  143239. "I2": "input",
  143240. "I3": "input",
  143241. "O": "output"
  143242. },
  143243. "connections": {
  143244. "I0": [ "0" ],
  143245. "I1": [ "0" ],
  143246. "I2": [ 5419 ],
  143247. "I3": [ 5921 ],
  143248. "O": [ 5739 ]
  143249. }
  143250. },
  143251. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O": {
  143252. "hide_name": 0,
  143253. "type": "SB_LUT4",
  143254. "parameters": {
  143255. "LUT_INIT": "0000111100110011"
  143256. },
  143257. "attributes": {
  143258. "module_not_derived": "00000000000000000000000000000001",
  143259. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143260. },
  143261. "port_directions": {
  143262. "I0": "input",
  143263. "I1": "input",
  143264. "I2": "input",
  143265. "I3": "input",
  143266. "O": "output"
  143267. },
  143268. "connections": {
  143269. "I0": [ "0" ],
  143270. "I1": [ 480 ],
  143271. "I2": [ 362 ],
  143272. "I3": [ 647 ],
  143273. "O": [ 5921 ]
  143274. }
  143275. },
  143276. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CI": {
  143277. "hide_name": 0,
  143278. "type": "SB_CARRY",
  143279. "parameters": {
  143280. },
  143281. "attributes": {
  143282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  143283. },
  143284. "port_directions": {
  143285. "CI": "input",
  143286. "CO": "output",
  143287. "I0": "input",
  143288. "I1": "input"
  143289. },
  143290. "connections": {
  143291. "CI": [ 5922 ],
  143292. "CO": [ 5923 ],
  143293. "I0": [ "0" ],
  143294. "I1": [ 5921 ]
  143295. }
  143296. },
  143297. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3": {
  143298. "hide_name": 0,
  143299. "type": "SB_LUT4",
  143300. "parameters": {
  143301. "LUT_INIT": "1000110010000000"
  143302. },
  143303. "attributes": {
  143304. "module_not_derived": "00000000000000000000000000000001",
  143305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143306. },
  143307. "port_directions": {
  143308. "I0": "input",
  143309. "I1": "input",
  143310. "I2": "input",
  143311. "I3": "input",
  143312. "O": "output"
  143313. },
  143314. "connections": {
  143315. "I0": [ 5489 ],
  143316. "I1": [ 5483 ],
  143317. "I2": [ 5465 ],
  143318. "I3": [ 5923 ],
  143319. "O": [ 5480 ]
  143320. }
  143321. },
  143322. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O": {
  143323. "hide_name": 0,
  143324. "type": "SB_LUT4",
  143325. "parameters": {
  143326. "LUT_INIT": "0101111101011100"
  143327. },
  143328. "attributes": {
  143329. "module_not_derived": "00000000000000000000000000000001",
  143330. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  143331. },
  143332. "port_directions": {
  143333. "I0": "input",
  143334. "I1": "input",
  143335. "I2": "input",
  143336. "I3": "input",
  143337. "O": "output"
  143338. },
  143339. "connections": {
  143340. "I0": [ 5461 ],
  143341. "I1": [ 133 ],
  143342. "I2": [ 5462 ],
  143343. "I3": [ 5451 ],
  143344. "O": [ 5479 ]
  143345. }
  143346. },
  143347. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O": {
  143348. "hide_name": 0,
  143349. "type": "SB_LUT4",
  143350. "parameters": {
  143351. "LUT_INIT": "0000111100110011"
  143352. },
  143353. "attributes": {
  143354. "module_not_derived": "00000000000000000000000000000001",
  143355. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143356. },
  143357. "port_directions": {
  143358. "I0": "input",
  143359. "I1": "input",
  143360. "I2": "input",
  143361. "I3": "input",
  143362. "O": "output"
  143363. },
  143364. "connections": {
  143365. "I0": [ "0" ],
  143366. "I1": [ 481 ],
  143367. "I2": [ 363 ],
  143368. "I3": [ 647 ],
  143369. "O": [ 5922 ]
  143370. }
  143371. },
  143372. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_DFFER_Q": {
  143373. "hide_name": 0,
  143374. "type": "SB_DFFER",
  143375. "parameters": {
  143376. },
  143377. "attributes": {
  143378. "module_not_derived": "00000000000000000000000000000001",
  143379. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:57.4-61.49|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  143380. },
  143381. "port_directions": {
  143382. "C": "input",
  143383. "D": "input",
  143384. "E": "input",
  143385. "Q": "output",
  143386. "R": "input"
  143387. },
  143388. "connections": {
  143389. "C": [ 42 ],
  143390. "D": [ 110 ],
  143391. "E": [ 5392 ],
  143392. "Q": [ 5920 ],
  143393. "R": [ 127 ]
  143394. }
  143395. },
  143396. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  143397. "hide_name": 0,
  143398. "type": "SB_DFF",
  143399. "parameters": {
  143400. },
  143401. "attributes": {
  143402. "BEL": " ",
  143403. "SERDES_ATTR": " ",
  143404. "SERDES_GRP": "00000000000000000011000000000010",
  143405. "dont_touch": "00000000000000000000000000000001",
  143406. "hdlname": "phy_I bit[3].osd_o_I genblk1[2].dff_cap_I genblk1.dff_I",
  143407. "keep": "00000000000000000000000000000001",
  143408. "module_not_derived": "00000000000000000000000000000001",
  143409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143410. },
  143411. "port_directions": {
  143412. "C": "input",
  143413. "D": "input",
  143414. "Q": "output"
  143415. },
  143416. "connections": {
  143417. "C": [ 42 ],
  143418. "D": [ 5919 ],
  143419. "Q": [ 5924 ]
  143420. }
  143421. },
  143422. "phy_I.bit[3].osd_o_I.genblk1[3].dff_cap_I.d_SB_DFF_Q": {
  143423. "hide_name": 0,
  143424. "type": "SB_DFF",
  143425. "parameters": {
  143426. },
  143427. "attributes": {
  143428. "module_not_derived": "00000000000000000000000000000001",
  143429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:700.2-711.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  143430. },
  143431. "port_directions": {
  143432. "C": "input",
  143433. "D": "input",
  143434. "Q": "output"
  143435. },
  143436. "connections": {
  143437. "C": [ 42 ],
  143438. "D": [ 5854 ],
  143439. "Q": [ 5691 ]
  143440. }
  143441. },
  143442. "phy_I.bit[3].osd_o_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  143443. "hide_name": 0,
  143444. "type": "SB_DFF",
  143445. "parameters": {
  143446. },
  143447. "attributes": {
  143448. "BEL": " ",
  143449. "SERDES_ATTR": " ",
  143450. "SERDES_GRP": "00000000000000000011000000000011",
  143451. "dont_touch": "00000000000000000000000000000001",
  143452. "hdlname": "phy_I bit[3].osd_o_I genblk1[3].dff_cap_I genblk1.dff_I",
  143453. "keep": "00000000000000000000000000000001",
  143454. "module_not_derived": "00000000000000000000000000000001",
  143455. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143456. },
  143457. "port_directions": {
  143458. "C": "input",
  143459. "D": "input",
  143460. "Q": "output"
  143461. },
  143462. "connections": {
  143463. "C": [ 42 ],
  143464. "D": [ 5691 ],
  143465. "Q": [ 5925 ]
  143466. }
  143467. },
  143468. "phy_I.bit[3].osd_o_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  143469. "hide_name": 0,
  143470. "type": "SB_LUT4",
  143471. "parameters": {
  143472. "LUT_INIT": "1111000000000000"
  143473. },
  143474. "attributes": {
  143475. "module_not_derived": "00000000000000000000000000000001",
  143476. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  143477. },
  143478. "port_directions": {
  143479. "I0": "input",
  143480. "I1": "input",
  143481. "I2": "input",
  143482. "I3": "input",
  143483. "O": "output"
  143484. },
  143485. "connections": {
  143486. "I0": [ "0" ],
  143487. "I1": [ "0" ],
  143488. "I2": [ 5912 ],
  143489. "I3": [ 5672 ],
  143490. "O": [ 5926 ]
  143491. }
  143492. },
  143493. "phy_I.bit[3].osd_o_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  143494. "hide_name": 0,
  143495. "type": "SB_DFF",
  143496. "parameters": {
  143497. },
  143498. "attributes": {
  143499. "BEL": " ",
  143500. "SERDES_ATTR": " ",
  143501. "SERDES_GRP": "00000000000000000011000000010000",
  143502. "dont_touch": "00000000000000000000000000000001",
  143503. "hdlname": "phy_I bit[3].osd_o_I genblk2[0].dff_shift_I genblk1.dff_I",
  143504. "keep": "00000000000000000000000000000001",
  143505. "module_not_derived": "00000000000000000000000000000001",
  143506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143507. },
  143508. "port_directions": {
  143509. "C": "input",
  143510. "D": "input",
  143511. "Q": "output"
  143512. },
  143513. "connections": {
  143514. "C": [ 5666 ],
  143515. "D": [ 5926 ],
  143516. "Q": [ 5927 ]
  143517. }
  143518. },
  143519. "phy_I.bit[3].osd_o_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  143520. "hide_name": 0,
  143521. "type": "SB_LUT4",
  143522. "parameters": {
  143523. "LUT_INIT": "1111000011001100"
  143524. },
  143525. "attributes": {
  143526. "module_not_derived": "00000000000000000000000000000001",
  143527. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143528. },
  143529. "port_directions": {
  143530. "I0": "input",
  143531. "I1": "input",
  143532. "I2": "input",
  143533. "I3": "input",
  143534. "O": "output"
  143535. },
  143536. "connections": {
  143537. "I0": [ "0" ],
  143538. "I1": [ 5927 ],
  143539. "I2": [ 5918 ],
  143540. "I3": [ 5672 ],
  143541. "O": [ 5928 ]
  143542. }
  143543. },
  143544. "phy_I.bit[3].osd_o_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  143545. "hide_name": 0,
  143546. "type": "SB_DFF",
  143547. "parameters": {
  143548. },
  143549. "attributes": {
  143550. "BEL": " ",
  143551. "SERDES_ATTR": " ",
  143552. "SERDES_GRP": "00000000000000000011000000010001",
  143553. "dont_touch": "00000000000000000000000000000001",
  143554. "hdlname": "phy_I bit[3].osd_o_I genblk2[1].dff_shift_I genblk1.dff_I",
  143555. "keep": "00000000000000000000000000000001",
  143556. "module_not_derived": "00000000000000000000000000000001",
  143557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143558. },
  143559. "port_directions": {
  143560. "C": "input",
  143561. "D": "input",
  143562. "Q": "output"
  143563. },
  143564. "connections": {
  143565. "C": [ 5666 ],
  143566. "D": [ 5928 ],
  143567. "Q": [ 5929 ]
  143568. }
  143569. },
  143570. "phy_I.bit[3].osd_o_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  143571. "hide_name": 0,
  143572. "type": "SB_LUT4",
  143573. "parameters": {
  143574. "LUT_INIT": "1111000011001100"
  143575. },
  143576. "attributes": {
  143577. "module_not_derived": "00000000000000000000000000000001",
  143578. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143579. },
  143580. "port_directions": {
  143581. "I0": "input",
  143582. "I1": "input",
  143583. "I2": "input",
  143584. "I3": "input",
  143585. "O": "output"
  143586. },
  143587. "connections": {
  143588. "I0": [ "0" ],
  143589. "I1": [ 5929 ],
  143590. "I2": [ 5924 ],
  143591. "I3": [ 5672 ],
  143592. "O": [ 5930 ]
  143593. }
  143594. },
  143595. "phy_I.bit[3].osd_o_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  143596. "hide_name": 0,
  143597. "type": "SB_DFF",
  143598. "parameters": {
  143599. },
  143600. "attributes": {
  143601. "BEL": " ",
  143602. "SERDES_ATTR": " ",
  143603. "SERDES_GRP": "00000000000000000011000000010010",
  143604. "dont_touch": "00000000000000000000000000000001",
  143605. "hdlname": "phy_I bit[3].osd_o_I genblk2[2].dff_shift_I genblk1.dff_I",
  143606. "keep": "00000000000000000000000000000001",
  143607. "module_not_derived": "00000000000000000000000000000001",
  143608. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143609. },
  143610. "port_directions": {
  143611. "C": "input",
  143612. "D": "input",
  143613. "Q": "output"
  143614. },
  143615. "connections": {
  143616. "C": [ 5666 ],
  143617. "D": [ 5930 ],
  143618. "Q": [ 5931 ]
  143619. }
  143620. },
  143621. "phy_I.bit[3].osd_o_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  143622. "hide_name": 0,
  143623. "type": "SB_LUT4",
  143624. "parameters": {
  143625. "LUT_INIT": "1111000011001100"
  143626. },
  143627. "attributes": {
  143628. "module_not_derived": "00000000000000000000000000000001",
  143629. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143630. },
  143631. "port_directions": {
  143632. "I0": "input",
  143633. "I1": "input",
  143634. "I2": "input",
  143635. "I3": "input",
  143636. "O": "output"
  143637. },
  143638. "connections": {
  143639. "I0": [ "0" ],
  143640. "I1": [ 5931 ],
  143641. "I2": [ 5925 ],
  143642. "I3": [ 5672 ],
  143643. "O": [ 5932 ]
  143644. }
  143645. },
  143646. "phy_I.bit[3].osd_o_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  143647. "hide_name": 0,
  143648. "type": "SB_DFF",
  143649. "parameters": {
  143650. },
  143651. "attributes": {
  143652. "BEL": " ",
  143653. "SERDES_ATTR": " ",
  143654. "SERDES_GRP": "00000000000000000011000000010011",
  143655. "dont_touch": "00000000000000000000000000000001",
  143656. "hdlname": "phy_I bit[3].osd_o_I genblk2[3].dff_shift_I genblk1.dff_I",
  143657. "keep": "00000000000000000000000000000001",
  143658. "module_not_derived": "00000000000000000000000000000001",
  143659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143660. },
  143661. "port_directions": {
  143662. "C": "input",
  143663. "D": "input",
  143664. "Q": "output"
  143665. },
  143666. "connections": {
  143667. "C": [ 5666 ],
  143668. "D": [ 5932 ],
  143669. "Q": [ 5933 ]
  143670. }
  143671. },
  143672. "phy_I.bit[3].osd_oe_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  143673. "hide_name": 0,
  143674. "type": "SB_DFF",
  143675. "parameters": {
  143676. },
  143677. "attributes": {
  143678. "BEL": " ",
  143679. "SERDES_ATTR": " ",
  143680. "SERDES_GRP": "00000000000000000011001000000000",
  143681. "dont_touch": "00000000000000000000000000000001",
  143682. "hdlname": "phy_I bit[3].osd_oe_I genblk1[0].dff_cap_I genblk1.dff_I",
  143683. "keep": "00000000000000000000000000000001",
  143684. "module_not_derived": "00000000000000000000000000000001",
  143685. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143686. },
  143687. "port_directions": {
  143688. "C": "input",
  143689. "D": "input",
  143690. "Q": "output"
  143691. },
  143692. "connections": {
  143693. "C": [ 42 ],
  143694. "D": [ 5612 ],
  143695. "Q": [ 5934 ]
  143696. }
  143697. },
  143698. "phy_I.bit[3].osd_oe_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  143699. "hide_name": 0,
  143700. "type": "SB_DFF",
  143701. "parameters": {
  143702. },
  143703. "attributes": {
  143704. "BEL": " ",
  143705. "SERDES_ATTR": " ",
  143706. "SERDES_GRP": "00000000000000000011001000000001",
  143707. "dont_touch": "00000000000000000000000000000001",
  143708. "hdlname": "phy_I bit[3].osd_oe_I genblk1[1].dff_cap_I genblk1.dff_I",
  143709. "keep": "00000000000000000000000000000001",
  143710. "module_not_derived": "00000000000000000000000000000001",
  143711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143712. },
  143713. "port_directions": {
  143714. "C": "input",
  143715. "D": "input",
  143716. "Q": "output"
  143717. },
  143718. "connections": {
  143719. "C": [ 42 ],
  143720. "D": [ 5612 ],
  143721. "Q": [ 5935 ]
  143722. }
  143723. },
  143724. "phy_I.bit[3].osd_oe_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  143725. "hide_name": 0,
  143726. "type": "SB_DFF",
  143727. "parameters": {
  143728. },
  143729. "attributes": {
  143730. "BEL": " ",
  143731. "SERDES_ATTR": " ",
  143732. "SERDES_GRP": "00000000000000000011001000000010",
  143733. "dont_touch": "00000000000000000000000000000001",
  143734. "hdlname": "phy_I bit[3].osd_oe_I genblk1[2].dff_cap_I genblk1.dff_I",
  143735. "keep": "00000000000000000000000000000001",
  143736. "module_not_derived": "00000000000000000000000000000001",
  143737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143738. },
  143739. "port_directions": {
  143740. "C": "input",
  143741. "D": "input",
  143742. "Q": "output"
  143743. },
  143744. "connections": {
  143745. "C": [ 42 ],
  143746. "D": [ 5612 ],
  143747. "Q": [ 5936 ]
  143748. }
  143749. },
  143750. "phy_I.bit[3].osd_oe_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  143751. "hide_name": 0,
  143752. "type": "SB_DFF",
  143753. "parameters": {
  143754. },
  143755. "attributes": {
  143756. "BEL": " ",
  143757. "SERDES_ATTR": " ",
  143758. "SERDES_GRP": "00000000000000000011001000000011",
  143759. "dont_touch": "00000000000000000000000000000001",
  143760. "hdlname": "phy_I bit[3].osd_oe_I genblk1[3].dff_cap_I genblk1.dff_I",
  143761. "keep": "00000000000000000000000000000001",
  143762. "module_not_derived": "00000000000000000000000000000001",
  143763. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143764. },
  143765. "port_directions": {
  143766. "C": "input",
  143767. "D": "input",
  143768. "Q": "output"
  143769. },
  143770. "connections": {
  143771. "C": [ 42 ],
  143772. "D": [ 5612 ],
  143773. "Q": [ 5937 ]
  143774. }
  143775. },
  143776. "phy_I.bit[3].osd_oe_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  143777. "hide_name": 0,
  143778. "type": "SB_LUT4",
  143779. "parameters": {
  143780. "LUT_INIT": "1111000000000000"
  143781. },
  143782. "attributes": {
  143783. "module_not_derived": "00000000000000000000000000000001",
  143784. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  143785. },
  143786. "port_directions": {
  143787. "I0": "input",
  143788. "I1": "input",
  143789. "I2": "input",
  143790. "I3": "input",
  143791. "O": "output"
  143792. },
  143793. "connections": {
  143794. "I0": [ "0" ],
  143795. "I1": [ "0" ],
  143796. "I2": [ 5934 ],
  143797. "I3": [ 5672 ],
  143798. "O": [ 5938 ]
  143799. }
  143800. },
  143801. "phy_I.bit[3].osd_oe_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  143802. "hide_name": 0,
  143803. "type": "SB_DFF",
  143804. "parameters": {
  143805. },
  143806. "attributes": {
  143807. "BEL": " ",
  143808. "SERDES_ATTR": " ",
  143809. "SERDES_GRP": "00000000000000000011001000010000",
  143810. "dont_touch": "00000000000000000000000000000001",
  143811. "hdlname": "phy_I bit[3].osd_oe_I genblk2[0].dff_shift_I genblk1.dff_I",
  143812. "keep": "00000000000000000000000000000001",
  143813. "module_not_derived": "00000000000000000000000000000001",
  143814. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143815. },
  143816. "port_directions": {
  143817. "C": "input",
  143818. "D": "input",
  143819. "Q": "output"
  143820. },
  143821. "connections": {
  143822. "C": [ 5666 ],
  143823. "D": [ 5938 ],
  143824. "Q": [ 5939 ]
  143825. }
  143826. },
  143827. "phy_I.bit[3].osd_oe_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  143828. "hide_name": 0,
  143829. "type": "SB_LUT4",
  143830. "parameters": {
  143831. "LUT_INIT": "1111000011001100"
  143832. },
  143833. "attributes": {
  143834. "module_not_derived": "00000000000000000000000000000001",
  143835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143836. },
  143837. "port_directions": {
  143838. "I0": "input",
  143839. "I1": "input",
  143840. "I2": "input",
  143841. "I3": "input",
  143842. "O": "output"
  143843. },
  143844. "connections": {
  143845. "I0": [ "0" ],
  143846. "I1": [ 5939 ],
  143847. "I2": [ 5935 ],
  143848. "I3": [ 5672 ],
  143849. "O": [ 5940 ]
  143850. }
  143851. },
  143852. "phy_I.bit[3].osd_oe_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  143853. "hide_name": 0,
  143854. "type": "SB_DFF",
  143855. "parameters": {
  143856. },
  143857. "attributes": {
  143858. "BEL": " ",
  143859. "SERDES_ATTR": " ",
  143860. "SERDES_GRP": "00000000000000000011001000010001",
  143861. "dont_touch": "00000000000000000000000000000001",
  143862. "hdlname": "phy_I bit[3].osd_oe_I genblk2[1].dff_shift_I genblk1.dff_I",
  143863. "keep": "00000000000000000000000000000001",
  143864. "module_not_derived": "00000000000000000000000000000001",
  143865. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143866. },
  143867. "port_directions": {
  143868. "C": "input",
  143869. "D": "input",
  143870. "Q": "output"
  143871. },
  143872. "connections": {
  143873. "C": [ 5666 ],
  143874. "D": [ 5940 ],
  143875. "Q": [ 5941 ]
  143876. }
  143877. },
  143878. "phy_I.bit[3].osd_oe_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  143879. "hide_name": 0,
  143880. "type": "SB_LUT4",
  143881. "parameters": {
  143882. "LUT_INIT": "1111000011001100"
  143883. },
  143884. "attributes": {
  143885. "module_not_derived": "00000000000000000000000000000001",
  143886. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143887. },
  143888. "port_directions": {
  143889. "I0": "input",
  143890. "I1": "input",
  143891. "I2": "input",
  143892. "I3": "input",
  143893. "O": "output"
  143894. },
  143895. "connections": {
  143896. "I0": [ "0" ],
  143897. "I1": [ 5941 ],
  143898. "I2": [ 5936 ],
  143899. "I3": [ 5672 ],
  143900. "O": [ 5942 ]
  143901. }
  143902. },
  143903. "phy_I.bit[3].osd_oe_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  143904. "hide_name": 0,
  143905. "type": "SB_DFF",
  143906. "parameters": {
  143907. },
  143908. "attributes": {
  143909. "BEL": " ",
  143910. "SERDES_ATTR": " ",
  143911. "SERDES_GRP": "00000000000000000011001000010010",
  143912. "dont_touch": "00000000000000000000000000000001",
  143913. "hdlname": "phy_I bit[3].osd_oe_I genblk2[2].dff_shift_I genblk1.dff_I",
  143914. "keep": "00000000000000000000000000000001",
  143915. "module_not_derived": "00000000000000000000000000000001",
  143916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143917. },
  143918. "port_directions": {
  143919. "C": "input",
  143920. "D": "input",
  143921. "Q": "output"
  143922. },
  143923. "connections": {
  143924. "C": [ 5666 ],
  143925. "D": [ 5942 ],
  143926. "Q": [ 5943 ]
  143927. }
  143928. },
  143929. "phy_I.bit[3].osd_oe_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  143930. "hide_name": 0,
  143931. "type": "SB_LUT4",
  143932. "parameters": {
  143933. "LUT_INIT": "1111000011001100"
  143934. },
  143935. "attributes": {
  143936. "module_not_derived": "00000000000000000000000000000001",
  143937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  143938. },
  143939. "port_directions": {
  143940. "I0": "input",
  143941. "I1": "input",
  143942. "I2": "input",
  143943. "I3": "input",
  143944. "O": "output"
  143945. },
  143946. "connections": {
  143947. "I0": [ "0" ],
  143948. "I1": [ 5943 ],
  143949. "I2": [ 5937 ],
  143950. "I3": [ 5672 ],
  143951. "O": [ 5944 ]
  143952. }
  143953. },
  143954. "phy_I.bit[3].osd_oe_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  143955. "hide_name": 0,
  143956. "type": "SB_DFF",
  143957. "parameters": {
  143958. },
  143959. "attributes": {
  143960. "BEL": " ",
  143961. "SERDES_ATTR": " ",
  143962. "SERDES_GRP": "00000000000000000011001000010011",
  143963. "dont_touch": "00000000000000000000000000000001",
  143964. "hdlname": "phy_I bit[3].osd_oe_I genblk2[3].dff_shift_I genblk1.dff_I",
  143965. "keep": "00000000000000000000000000000001",
  143966. "module_not_derived": "00000000000000000000000000000001",
  143967. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  143968. },
  143969. "port_directions": {
  143970. "C": "input",
  143971. "D": "input",
  143972. "Q": "output"
  143973. },
  143974. "connections": {
  143975. "C": [ 5666 ],
  143976. "D": [ 5944 ],
  143977. "Q": [ 5945 ]
  143978. }
  143979. },
  143980. "phy_I.genblk2.iob_clk_I": {
  143981. "hide_name": 0,
  143982. "type": "SB_IO",
  143983. "parameters": {
  143984. "IO_STANDARD": "SB_LVCMOS",
  143985. "NEG_TRIGGER": "0",
  143986. "PIN_TYPE": "010011",
  143987. "PULLUP": "0"
  143988. },
  143989. "attributes": {
  143990. "hdlname": "phy_I genblk2.iob_clk_I",
  143991. "module_not_derived": "00000000000000000000000000000001",
  143992. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:147.6-152.5"
  143993. },
  143994. "port_directions": {
  143995. "CLOCK_ENABLE": "input",
  143996. "D_OUT_0": "input",
  143997. "D_OUT_1": "input",
  143998. "OUTPUT_CLK": "input",
  143999. "PACKAGE_PIN": "inout"
  144000. },
  144001. "connections": {
  144002. "CLOCK_ENABLE": [ "1" ],
  144003. "D_OUT_0": [ "0" ],
  144004. "D_OUT_1": [ 5946 ],
  144005. "OUTPUT_CLK": [ 5666 ],
  144006. "PACKAGE_PIN": [ 6 ]
  144007. }
  144008. },
  144009. "phy_I.genblk2.osd_clk_I.genblk1[0].dff_cap_I.d_SB_LUT4_O": {
  144010. "hide_name": 0,
  144011. "type": "SB_LUT4",
  144012. "parameters": {
  144013. "LUT_INIT": "1100000011001100"
  144014. },
  144015. "attributes": {
  144016. "module_not_derived": "00000000000000000000000000000001",
  144017. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144018. },
  144019. "port_directions": {
  144020. "I0": "input",
  144021. "I1": "input",
  144022. "I2": "input",
  144023. "I3": "input",
  144024. "O": "output"
  144025. },
  144026. "connections": {
  144027. "I0": [ "0" ],
  144028. "I1": [ 5461 ],
  144029. "I2": [ 5560 ],
  144030. "I3": [ 5553 ],
  144031. "O": [ 5947 ]
  144032. }
  144033. },
  144034. "phy_I.genblk2.osd_clk_I.genblk1[0].dff_cap_I.genblk1.dff_I": {
  144035. "hide_name": 0,
  144036. "type": "SB_DFF",
  144037. "parameters": {
  144038. },
  144039. "attributes": {
  144040. "BEL": " ",
  144041. "SERDES_ATTR": " ",
  144042. "SERDES_GRP": "00000000000000000100000000000000",
  144043. "dont_touch": "00000000000000000000000000000001",
  144044. "hdlname": "phy_I genblk2.osd_clk_I genblk1[0].dff_cap_I genblk1.dff_I",
  144045. "keep": "00000000000000000000000000000001",
  144046. "module_not_derived": "00000000000000000000000000000001",
  144047. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144048. },
  144049. "port_directions": {
  144050. "C": "input",
  144051. "D": "input",
  144052. "Q": "output"
  144053. },
  144054. "connections": {
  144055. "C": [ 42 ],
  144056. "D": [ 5947 ],
  144057. "Q": [ 5948 ]
  144058. }
  144059. },
  144060. "phy_I.genblk2.osd_clk_I.genblk1[1].dff_cap_I.genblk1.dff_I": {
  144061. "hide_name": 0,
  144062. "type": "SB_DFF",
  144063. "parameters": {
  144064. },
  144065. "attributes": {
  144066. "BEL": " ",
  144067. "SERDES_ATTR": " ",
  144068. "SERDES_GRP": "00000000000000000100000000000001",
  144069. "dont_touch": "00000000000000000000000000000001",
  144070. "hdlname": "phy_I genblk2.osd_clk_I genblk1[1].dff_cap_I genblk1.dff_I",
  144071. "keep": "00000000000000000000000000000001",
  144072. "module_not_derived": "00000000000000000000000000000001",
  144073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144074. },
  144075. "port_directions": {
  144076. "C": "input",
  144077. "D": "input",
  144078. "Q": "output"
  144079. },
  144080. "connections": {
  144081. "C": [ 42 ],
  144082. "D": [ 5947 ],
  144083. "Q": [ 5949 ]
  144084. }
  144085. },
  144086. "phy_I.genblk2.osd_clk_I.genblk1[2].dff_cap_I.genblk1.dff_I": {
  144087. "hide_name": 0,
  144088. "type": "SB_DFF",
  144089. "parameters": {
  144090. },
  144091. "attributes": {
  144092. "BEL": " ",
  144093. "SERDES_ATTR": " ",
  144094. "SERDES_GRP": "00000000000000000100000000000010",
  144095. "dont_touch": "00000000000000000000000000000001",
  144096. "hdlname": "phy_I genblk2.osd_clk_I genblk1[2].dff_cap_I genblk1.dff_I",
  144097. "keep": "00000000000000000000000000000001",
  144098. "module_not_derived": "00000000000000000000000000000001",
  144099. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144100. },
  144101. "port_directions": {
  144102. "C": "input",
  144103. "D": "input",
  144104. "Q": "output"
  144105. },
  144106. "connections": {
  144107. "C": [ 42 ],
  144108. "D": [ 5461 ],
  144109. "Q": [ 5950 ]
  144110. }
  144111. },
  144112. "phy_I.genblk2.osd_clk_I.genblk1[3].dff_cap_I.genblk1.dff_I": {
  144113. "hide_name": 0,
  144114. "type": "SB_DFF",
  144115. "parameters": {
  144116. },
  144117. "attributes": {
  144118. "BEL": " ",
  144119. "SERDES_ATTR": " ",
  144120. "SERDES_GRP": "00000000000000000100000000000011",
  144121. "dont_touch": "00000000000000000000000000000001",
  144122. "hdlname": "phy_I genblk2.osd_clk_I genblk1[3].dff_cap_I genblk1.dff_I",
  144123. "keep": "00000000000000000000000000000001",
  144124. "module_not_derived": "00000000000000000000000000000001",
  144125. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144126. },
  144127. "port_directions": {
  144128. "C": "input",
  144129. "D": "input",
  144130. "Q": "output"
  144131. },
  144132. "connections": {
  144133. "C": [ 42 ],
  144134. "D": [ 5461 ],
  144135. "Q": [ 5951 ]
  144136. }
  144137. },
  144138. "phy_I.genblk2.osd_clk_I.genblk2[0].dff_shift_I.d_SB_LUT4_O": {
  144139. "hide_name": 0,
  144140. "type": "SB_LUT4",
  144141. "parameters": {
  144142. "LUT_INIT": "1111000000000000"
  144143. },
  144144. "attributes": {
  144145. "module_not_derived": "00000000000000000000000000000001",
  144146. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  144147. },
  144148. "port_directions": {
  144149. "I0": "input",
  144150. "I1": "input",
  144151. "I2": "input",
  144152. "I3": "input",
  144153. "O": "output"
  144154. },
  144155. "connections": {
  144156. "I0": [ "0" ],
  144157. "I1": [ "0" ],
  144158. "I2": [ 5948 ],
  144159. "I3": [ 5672 ],
  144160. "O": [ 5952 ]
  144161. }
  144162. },
  144163. "phy_I.genblk2.osd_clk_I.genblk2[0].dff_shift_I.genblk1.dff_I": {
  144164. "hide_name": 0,
  144165. "type": "SB_DFF",
  144166. "parameters": {
  144167. },
  144168. "attributes": {
  144169. "BEL": " ",
  144170. "SERDES_ATTR": " ",
  144171. "SERDES_GRP": "00000000000000000100000000010000",
  144172. "dont_touch": "00000000000000000000000000000001",
  144173. "hdlname": "phy_I genblk2.osd_clk_I genblk2[0].dff_shift_I genblk1.dff_I",
  144174. "keep": "00000000000000000000000000000001",
  144175. "module_not_derived": "00000000000000000000000000000001",
  144176. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144177. },
  144178. "port_directions": {
  144179. "C": "input",
  144180. "D": "input",
  144181. "Q": "output"
  144182. },
  144183. "connections": {
  144184. "C": [ 5666 ],
  144185. "D": [ 5952 ],
  144186. "Q": [ 5953 ]
  144187. }
  144188. },
  144189. "phy_I.genblk2.osd_clk_I.genblk2[1].dff_shift_I.d_SB_LUT4_O": {
  144190. "hide_name": 0,
  144191. "type": "SB_LUT4",
  144192. "parameters": {
  144193. "LUT_INIT": "1111000011001100"
  144194. },
  144195. "attributes": {
  144196. "module_not_derived": "00000000000000000000000000000001",
  144197. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144198. },
  144199. "port_directions": {
  144200. "I0": "input",
  144201. "I1": "input",
  144202. "I2": "input",
  144203. "I3": "input",
  144204. "O": "output"
  144205. },
  144206. "connections": {
  144207. "I0": [ "0" ],
  144208. "I1": [ 5953 ],
  144209. "I2": [ 5949 ],
  144210. "I3": [ 5672 ],
  144211. "O": [ 5954 ]
  144212. }
  144213. },
  144214. "phy_I.genblk2.osd_clk_I.genblk2[1].dff_shift_I.genblk1.dff_I": {
  144215. "hide_name": 0,
  144216. "type": "SB_DFF",
  144217. "parameters": {
  144218. },
  144219. "attributes": {
  144220. "BEL": " ",
  144221. "SERDES_ATTR": " ",
  144222. "SERDES_GRP": "00000000000000000100000000010001",
  144223. "dont_touch": "00000000000000000000000000000001",
  144224. "hdlname": "phy_I genblk2.osd_clk_I genblk2[1].dff_shift_I genblk1.dff_I",
  144225. "keep": "00000000000000000000000000000001",
  144226. "module_not_derived": "00000000000000000000000000000001",
  144227. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144228. },
  144229. "port_directions": {
  144230. "C": "input",
  144231. "D": "input",
  144232. "Q": "output"
  144233. },
  144234. "connections": {
  144235. "C": [ 5666 ],
  144236. "D": [ 5954 ],
  144237. "Q": [ 5955 ]
  144238. }
  144239. },
  144240. "phy_I.genblk2.osd_clk_I.genblk2[2].dff_shift_I.d_SB_LUT4_O": {
  144241. "hide_name": 0,
  144242. "type": "SB_LUT4",
  144243. "parameters": {
  144244. "LUT_INIT": "1111000011001100"
  144245. },
  144246. "attributes": {
  144247. "module_not_derived": "00000000000000000000000000000001",
  144248. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144249. },
  144250. "port_directions": {
  144251. "I0": "input",
  144252. "I1": "input",
  144253. "I2": "input",
  144254. "I3": "input",
  144255. "O": "output"
  144256. },
  144257. "connections": {
  144258. "I0": [ "0" ],
  144259. "I1": [ 5955 ],
  144260. "I2": [ 5950 ],
  144261. "I3": [ 5672 ],
  144262. "O": [ 5956 ]
  144263. }
  144264. },
  144265. "phy_I.genblk2.osd_clk_I.genblk2[2].dff_shift_I.genblk1.dff_I": {
  144266. "hide_name": 0,
  144267. "type": "SB_DFF",
  144268. "parameters": {
  144269. },
  144270. "attributes": {
  144271. "BEL": " ",
  144272. "SERDES_ATTR": " ",
  144273. "SERDES_GRP": "00000000000000000100000000010010",
  144274. "dont_touch": "00000000000000000000000000000001",
  144275. "hdlname": "phy_I genblk2.osd_clk_I genblk2[2].dff_shift_I genblk1.dff_I",
  144276. "keep": "00000000000000000000000000000001",
  144277. "module_not_derived": "00000000000000000000000000000001",
  144278. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144279. },
  144280. "port_directions": {
  144281. "C": "input",
  144282. "D": "input",
  144283. "Q": "output"
  144284. },
  144285. "connections": {
  144286. "C": [ 5666 ],
  144287. "D": [ 5956 ],
  144288. "Q": [ 5957 ]
  144289. }
  144290. },
  144291. "phy_I.genblk2.osd_clk_I.genblk2[3].dff_shift_I.d_SB_LUT4_O": {
  144292. "hide_name": 0,
  144293. "type": "SB_LUT4",
  144294. "parameters": {
  144295. "LUT_INIT": "1111000011001100"
  144296. },
  144297. "attributes": {
  144298. "module_not_derived": "00000000000000000000000000000001",
  144299. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144300. },
  144301. "port_directions": {
  144302. "I0": "input",
  144303. "I1": "input",
  144304. "I2": "input",
  144305. "I3": "input",
  144306. "O": "output"
  144307. },
  144308. "connections": {
  144309. "I0": [ "0" ],
  144310. "I1": [ 5957 ],
  144311. "I2": [ 5951 ],
  144312. "I3": [ 5672 ],
  144313. "O": [ 5958 ]
  144314. }
  144315. },
  144316. "phy_I.genblk2.osd_clk_I.genblk2[3].dff_shift_I.genblk1.dff_I": {
  144317. "hide_name": 0,
  144318. "type": "SB_DFF",
  144319. "parameters": {
  144320. },
  144321. "attributes": {
  144322. "BEL": " ",
  144323. "SERDES_ATTR": " ",
  144324. "SERDES_GRP": "00000000000000000100000000010011",
  144325. "dont_touch": "00000000000000000000000000000001",
  144326. "hdlname": "phy_I genblk2.osd_clk_I genblk2[3].dff_shift_I genblk1.dff_I",
  144327. "keep": "00000000000000000000000000000001",
  144328. "module_not_derived": "00000000000000000000000000000001",
  144329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144330. },
  144331. "port_directions": {
  144332. "C": "input",
  144333. "D": "input",
  144334. "Q": "output"
  144335. },
  144336. "connections": {
  144337. "C": [ 5666 ],
  144338. "D": [ 5958 ],
  144339. "Q": [ 5959 ]
  144340. }
  144341. },
  144342. "phy_I.genblk2.osd_clk_I.genblk3.dff_out_I.genblk1.dff_I": {
  144343. "hide_name": 0,
  144344. "type": "SB_DFF",
  144345. "parameters": {
  144346. },
  144347. "attributes": {
  144348. "BEL": " ",
  144349. "SERDES_ATTR": " ",
  144350. "SERDES_GRP": "00000000000000000100000000100000",
  144351. "dont_touch": "00000000000000000000000000000001",
  144352. "hdlname": "phy_I genblk2.osd_clk_I genblk3.dff_out_I genblk1.dff_I",
  144353. "keep": "00000000000000000000000000000001",
  144354. "module_not_derived": "00000000000000000000000000000001",
  144355. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:32.11-36.5"
  144356. },
  144357. "port_directions": {
  144358. "C": "input",
  144359. "D": "input",
  144360. "Q": "output"
  144361. },
  144362. "connections": {
  144363. "C": [ 5666 ],
  144364. "D": [ 5959 ],
  144365. "Q": [ 5946 ]
  144366. }
  144367. },
  144368. "phy_I.genblk3.iob_spi_cs_I[0]": {
  144369. "hide_name": 0,
  144370. "type": "SB_IO",
  144371. "parameters": {
  144372. "IO_STANDARD": "SB_LVCMOS",
  144373. "NEG_TRIGGER": "0",
  144374. "PIN_TYPE": "011011",
  144375. "PULLUP": "1"
  144376. },
  144377. "attributes": {
  144378. "hdlname": "phy_I genblk3.iob_spi_cs_I[0]",
  144379. "module_not_derived": "00000000000000000000000000000001",
  144380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:174.6-177.5"
  144381. },
  144382. "port_directions": {
  144383. "CLOCK_ENABLE": "input",
  144384. "D_OUT_0": "input",
  144385. "PACKAGE_PIN": "inout"
  144386. },
  144387. "connections": {
  144388. "CLOCK_ENABLE": [ "1" ],
  144389. "D_OUT_0": [ 5960 ],
  144390. "PACKAGE_PIN": [ 7 ]
  144391. }
  144392. },
  144393. "phy_I.genblk3.iob_spi_cs_I[1]": {
  144394. "hide_name": 0,
  144395. "type": "SB_IO",
  144396. "parameters": {
  144397. "IO_STANDARD": "SB_LVCMOS",
  144398. "NEG_TRIGGER": "0",
  144399. "PIN_TYPE": "011011",
  144400. "PULLUP": "1"
  144401. },
  144402. "attributes": {
  144403. "hdlname": "phy_I genblk3.iob_spi_cs_I[1]",
  144404. "module_not_derived": "00000000000000000000000000000001",
  144405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:174.6-177.5"
  144406. },
  144407. "port_directions": {
  144408. "CLOCK_ENABLE": "input",
  144409. "D_OUT_0": "input",
  144410. "PACKAGE_PIN": "inout"
  144411. },
  144412. "connections": {
  144413. "CLOCK_ENABLE": [ "1" ],
  144414. "D_OUT_0": [ 5961 ],
  144415. "PACKAGE_PIN": [ 8 ]
  144416. }
  144417. },
  144418. "phy_I.iob_cs_o_SB_DFF_Q": {
  144419. "hide_name": 0,
  144420. "type": "SB_DFF",
  144421. "parameters": {
  144422. },
  144423. "attributes": {
  144424. "module_not_derived": "00000000000000000000000000000001",
  144425. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:163.4-164.26|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  144426. },
  144427. "port_directions": {
  144428. "C": "input",
  144429. "D": "input",
  144430. "Q": "output"
  144431. },
  144432. "connections": {
  144433. "C": [ 42 ],
  144434. "D": [ 5476 ],
  144435. "Q": [ 5961 ]
  144436. }
  144437. },
  144438. "phy_I.iob_cs_o_SB_DFF_Q_1": {
  144439. "hide_name": 0,
  144440. "type": "SB_DFF",
  144441. "parameters": {
  144442. },
  144443. "attributes": {
  144444. "module_not_derived": "00000000000000000000000000000001",
  144445. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:163.4-164.26|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  144446. },
  144447. "port_directions": {
  144448. "C": "input",
  144449. "D": "input",
  144450. "Q": "output"
  144451. },
  144452. "connections": {
  144453. "C": [ 42 ],
  144454. "D": [ 5478 ],
  144455. "Q": [ 5960 ]
  144456. }
  144457. },
  144458. "phy_I.iob_spi_io_I[0]": {
  144459. "hide_name": 0,
  144460. "type": "SB_IO",
  144461. "parameters": {
  144462. "IO_STANDARD": "SB_LVCMOS",
  144463. "NEG_TRIGGER": "0",
  144464. "PIN_TYPE": "110100",
  144465. "PULLUP": "0"
  144466. },
  144467. "attributes": {
  144468. "hdlname": "phy_I iob_spi_io_I[0]",
  144469. "module_not_derived": "00000000000000000000000000000001",
  144470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:111.4-119.3"
  144471. },
  144472. "port_directions": {
  144473. "CLOCK_ENABLE": "input",
  144474. "D_IN_0": "output",
  144475. "D_IN_1": "output",
  144476. "D_OUT_0": "input",
  144477. "INPUT_CLK": "input",
  144478. "OUTPUT_CLK": "input",
  144479. "OUTPUT_ENABLE": "input",
  144480. "PACKAGE_PIN": "inout"
  144481. },
  144482. "connections": {
  144483. "CLOCK_ENABLE": [ "1" ],
  144484. "D_IN_0": [ 5962 ],
  144485. "D_IN_1": [ 5667 ],
  144486. "D_OUT_0": [ 5701 ],
  144487. "INPUT_CLK": [ 5666 ],
  144488. "OUTPUT_CLK": [ 5666 ],
  144489. "OUTPUT_ENABLE": [ 5714 ],
  144490. "PACKAGE_PIN": [ 2 ]
  144491. }
  144492. },
  144493. "phy_I.iob_spi_io_I[1]": {
  144494. "hide_name": 0,
  144495. "type": "SB_IO",
  144496. "parameters": {
  144497. "IO_STANDARD": "SB_LVCMOS",
  144498. "NEG_TRIGGER": "0",
  144499. "PIN_TYPE": "110100",
  144500. "PULLUP": "0"
  144501. },
  144502. "attributes": {
  144503. "hdlname": "phy_I iob_spi_io_I[1]",
  144504. "module_not_derived": "00000000000000000000000000000001",
  144505. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:111.4-119.3"
  144506. },
  144507. "port_directions": {
  144508. "CLOCK_ENABLE": "input",
  144509. "D_IN_0": "output",
  144510. "D_IN_1": "output",
  144511. "D_OUT_0": "input",
  144512. "INPUT_CLK": "input",
  144513. "OUTPUT_CLK": "input",
  144514. "OUTPUT_ENABLE": "input",
  144515. "PACKAGE_PIN": "inout"
  144516. },
  144517. "connections": {
  144518. "CLOCK_ENABLE": [ "1" ],
  144519. "D_IN_0": [ 5963 ],
  144520. "D_IN_1": [ 5715 ],
  144521. "D_OUT_0": [ 5762 ],
  144522. "INPUT_CLK": [ 5666 ],
  144523. "OUTPUT_CLK": [ 5666 ],
  144524. "OUTPUT_ENABLE": [ 5774 ],
  144525. "PACKAGE_PIN": [ 3 ]
  144526. }
  144527. },
  144528. "phy_I.iob_spi_io_I[2]": {
  144529. "hide_name": 0,
  144530. "type": "SB_IO",
  144531. "parameters": {
  144532. "IO_STANDARD": "SB_LVCMOS",
  144533. "NEG_TRIGGER": "0",
  144534. "PIN_TYPE": "110100",
  144535. "PULLUP": "0"
  144536. },
  144537. "attributes": {
  144538. "hdlname": "phy_I iob_spi_io_I[2]",
  144539. "module_not_derived": "00000000000000000000000000000001",
  144540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:111.4-119.3"
  144541. },
  144542. "port_directions": {
  144543. "CLOCK_ENABLE": "input",
  144544. "D_IN_0": "output",
  144545. "D_IN_1": "output",
  144546. "D_OUT_0": "input",
  144547. "INPUT_CLK": "input",
  144548. "OUTPUT_CLK": "input",
  144549. "OUTPUT_ENABLE": "input",
  144550. "PACKAGE_PIN": "inout"
  144551. },
  144552. "connections": {
  144553. "CLOCK_ENABLE": [ "1" ],
  144554. "D_IN_0": [ 5964 ],
  144555. "D_IN_1": [ 5775 ],
  144556. "D_OUT_0": [ 5883 ],
  144557. "INPUT_CLK": [ 5666 ],
  144558. "OUTPUT_CLK": [ 5666 ],
  144559. "OUTPUT_ENABLE": [ 5895 ],
  144560. "PACKAGE_PIN": [ 4 ]
  144561. }
  144562. },
  144563. "phy_I.iob_spi_io_I[3]": {
  144564. "hide_name": 0,
  144565. "type": "SB_IO",
  144566. "parameters": {
  144567. "IO_STANDARD": "SB_LVCMOS",
  144568. "NEG_TRIGGER": "0",
  144569. "PIN_TYPE": "110100",
  144570. "PULLUP": "0"
  144571. },
  144572. "attributes": {
  144573. "hdlname": "phy_I iob_spi_io_I[3]",
  144574. "module_not_derived": "00000000000000000000000000000001",
  144575. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:111.4-119.3"
  144576. },
  144577. "port_directions": {
  144578. "CLOCK_ENABLE": "input",
  144579. "D_IN_0": "output",
  144580. "D_IN_1": "output",
  144581. "D_OUT_0": "input",
  144582. "INPUT_CLK": "input",
  144583. "OUTPUT_CLK": "input",
  144584. "OUTPUT_ENABLE": "input",
  144585. "PACKAGE_PIN": "inout"
  144586. },
  144587. "connections": {
  144588. "CLOCK_ENABLE": [ "1" ],
  144589. "D_IN_0": [ 5965 ],
  144590. "D_IN_1": [ 5896 ],
  144591. "D_OUT_0": [ 5933 ],
  144592. "INPUT_CLK": [ 5666 ],
  144593. "OUTPUT_CLK": [ 5666 ],
  144594. "OUTPUT_ENABLE": [ 5945 ],
  144595. "PACKAGE_PIN": [ 5 ]
  144596. }
  144597. },
  144598. "rgb_I.led_I": {
  144599. "hide_name": 0,
  144600. "type": "SB_LEDDA_IP",
  144601. "parameters": {
  144602. },
  144603. "attributes": {
  144604. "hdlname": "rgb_I led_I",
  144605. "module_not_derived": "00000000000000000000000000000001",
  144606. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:47.14-68.3"
  144607. },
  144608. "port_directions": {
  144609. "LEDDADDR0": "input",
  144610. "LEDDADDR1": "input",
  144611. "LEDDADDR2": "input",
  144612. "LEDDADDR3": "input",
  144613. "LEDDCLK": "input",
  144614. "LEDDCS": "input",
  144615. "LEDDDAT0": "input",
  144616. "LEDDDAT1": "input",
  144617. "LEDDDAT2": "input",
  144618. "LEDDDAT3": "input",
  144619. "LEDDDAT4": "input",
  144620. "LEDDDAT5": "input",
  144621. "LEDDDAT6": "input",
  144622. "LEDDDAT7": "input",
  144623. "LEDDDEN": "input",
  144624. "LEDDEXE": "input",
  144625. "LEDDON": "output",
  144626. "PWMOUT0": "output",
  144627. "PWMOUT1": "output",
  144628. "PWMOUT2": "output"
  144629. },
  144630. "connections": {
  144631. "LEDDADDR0": [ 706 ],
  144632. "LEDDADDR1": [ 704 ],
  144633. "LEDDADDR2": [ 701 ],
  144634. "LEDDADDR3": [ 699 ],
  144635. "LEDDCLK": [ 42 ],
  144636. "LEDDCS": [ 5387 ],
  144637. "LEDDDAT0": [ 60 ],
  144638. "LEDDDAT1": [ 68 ],
  144639. "LEDDDAT2": [ 64 ],
  144640. "LEDDDAT3": [ 72 ],
  144641. "LEDDDAT4": [ 62 ],
  144642. "LEDDDAT5": [ 70 ],
  144643. "LEDDDAT6": [ 66 ],
  144644. "LEDDDAT7": [ 74 ],
  144645. "LEDDDEN": [ 5966 ],
  144646. "LEDDEXE": [ 5967 ],
  144647. "LEDDON": [ ],
  144648. "PWMOUT0": [ 5968 ],
  144649. "PWMOUT1": [ 5969 ],
  144650. "PWMOUT2": [ 5970 ]
  144651. }
  144652. },
  144653. "rgb_I.led_I_LEDDCS_SB_LUT4_O": {
  144654. "hide_name": 0,
  144655. "type": "SB_LUT4",
  144656. "parameters": {
  144657. "LUT_INIT": "1111000000000000"
  144658. },
  144659. "attributes": {
  144660. "module_not_derived": "00000000000000000000000000000001",
  144661. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  144662. },
  144663. "port_directions": {
  144664. "I0": "input",
  144665. "I1": "input",
  144666. "I2": "input",
  144667. "I3": "input",
  144668. "O": "output"
  144669. },
  144670. "connections": {
  144671. "I0": [ "0" ],
  144672. "I1": [ "0" ],
  144673. "I2": [ 697 ],
  144674. "I3": [ 469 ],
  144675. "O": [ 5387 ]
  144676. }
  144677. },
  144678. "rgb_I.led_ctrl_SB_DFFR_Q": {
  144679. "hide_name": 0,
  144680. "type": "SB_DFFR",
  144681. "parameters": {
  144682. },
  144683. "attributes": {
  144684. "module_not_derived": "00000000000000000000000000000001",
  144685. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:94.2-98.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  144686. },
  144687. "port_directions": {
  144688. "C": "input",
  144689. "D": "input",
  144690. "Q": "output",
  144691. "R": "input"
  144692. },
  144693. "connections": {
  144694. "C": [ 42 ],
  144695. "D": [ 5971 ],
  144696. "Q": [ 5972 ],
  144697. "R": [ 127 ]
  144698. }
  144699. },
  144700. "rgb_I.led_ctrl_SB_DFFR_Q_1": {
  144701. "hide_name": 0,
  144702. "type": "SB_DFFR",
  144703. "parameters": {
  144704. },
  144705. "attributes": {
  144706. "module_not_derived": "00000000000000000000000000000001",
  144707. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:94.2-98.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  144708. },
  144709. "port_directions": {
  144710. "C": "input",
  144711. "D": "input",
  144712. "Q": "output",
  144713. "R": "input"
  144714. },
  144715. "connections": {
  144716. "C": [ 42 ],
  144717. "D": [ 5973 ],
  144718. "Q": [ 5974 ],
  144719. "R": [ 127 ]
  144720. }
  144721. },
  144722. "rgb_I.led_ctrl_SB_DFFR_Q_1_D_SB_LUT4_O": {
  144723. "hide_name": 0,
  144724. "type": "SB_LUT4",
  144725. "parameters": {
  144726. "LUT_INIT": "1100110011110000"
  144727. },
  144728. "attributes": {
  144729. "module_not_derived": "00000000000000000000000000000001",
  144730. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144731. },
  144732. "port_directions": {
  144733. "I0": "input",
  144734. "I1": "input",
  144735. "I2": "input",
  144736. "I3": "input",
  144737. "O": "output"
  144738. },
  144739. "connections": {
  144740. "I0": [ "0" ],
  144741. "I1": [ 64 ],
  144742. "I2": [ 5974 ],
  144743. "I3": [ 5975 ],
  144744. "O": [ 5973 ]
  144745. }
  144746. },
  144747. "rgb_I.led_ctrl_SB_DFFR_Q_2": {
  144748. "hide_name": 0,
  144749. "type": "SB_DFFR",
  144750. "parameters": {
  144751. },
  144752. "attributes": {
  144753. "module_not_derived": "00000000000000000000000000000001",
  144754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:94.2-98.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  144755. },
  144756. "port_directions": {
  144757. "C": "input",
  144758. "D": "input",
  144759. "Q": "output",
  144760. "R": "input"
  144761. },
  144762. "connections": {
  144763. "C": [ 42 ],
  144764. "D": [ 5976 ],
  144765. "Q": [ 5967 ],
  144766. "R": [ 127 ]
  144767. }
  144768. },
  144769. "rgb_I.led_ctrl_SB_DFFR_Q_2_D_SB_LUT4_O": {
  144770. "hide_name": 0,
  144771. "type": "SB_LUT4",
  144772. "parameters": {
  144773. "LUT_INIT": "1100110011110000"
  144774. },
  144775. "attributes": {
  144776. "module_not_derived": "00000000000000000000000000000001",
  144777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144778. },
  144779. "port_directions": {
  144780. "I0": "input",
  144781. "I1": "input",
  144782. "I2": "input",
  144783. "I3": "input",
  144784. "O": "output"
  144785. },
  144786. "connections": {
  144787. "I0": [ "0" ],
  144788. "I1": [ 68 ],
  144789. "I2": [ 5967 ],
  144790. "I3": [ 5975 ],
  144791. "O": [ 5976 ]
  144792. }
  144793. },
  144794. "rgb_I.led_ctrl_SB_DFFR_Q_D_SB_LUT4_O": {
  144795. "hide_name": 0,
  144796. "type": "SB_LUT4",
  144797. "parameters": {
  144798. "LUT_INIT": "1100110011110000"
  144799. },
  144800. "attributes": {
  144801. "module_not_derived": "00000000000000000000000000000001",
  144802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144803. },
  144804. "port_directions": {
  144805. "I0": "input",
  144806. "I1": "input",
  144807. "I2": "input",
  144808. "I3": "input",
  144809. "O": "output"
  144810. },
  144811. "connections": {
  144812. "I0": [ "0" ],
  144813. "I1": [ 72 ],
  144814. "I2": [ 5972 ],
  144815. "I3": [ 5975 ],
  144816. "O": [ 5971 ]
  144817. }
  144818. },
  144819. "rgb_I.rgb_drv_I": {
  144820. "hide_name": 0,
  144821. "type": "SB_RGBA_DRV",
  144822. "parameters": {
  144823. "CURRENT_MODE": "0b1",
  144824. "RGB0_CURRENT": "0b000001",
  144825. "RGB1_CURRENT": "0b000001",
  144826. "RGB2_CURRENT": "0b000001"
  144827. },
  144828. "attributes": {
  144829. "hdlname": "rgb_I rgb_drv_I",
  144830. "module_not_derived": "00000000000000000000000000000001",
  144831. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:79.4-88.3"
  144832. },
  144833. "port_directions": {
  144834. "CURREN": "input",
  144835. "RGB0": "output",
  144836. "RGB0PWM": "input",
  144837. "RGB1": "output",
  144838. "RGB1PWM": "input",
  144839. "RGB2": "output",
  144840. "RGB2PWM": "input",
  144841. "RGBLEDEN": "input"
  144842. },
  144843. "connections": {
  144844. "CURREN": [ 5972 ],
  144845. "RGB0": [ 28 ],
  144846. "RGB0PWM": [ 5968 ],
  144847. "RGB1": [ 29 ],
  144848. "RGB1PWM": [ 5969 ],
  144849. "RGB2": [ 30 ],
  144850. "RGB2PWM": [ 5970 ],
  144851. "RGBLEDEN": [ 5974 ]
  144852. }
  144853. },
  144854. "rgb_I.wb_ack_SB_DFFSR_Q": {
  144855. "hide_name": 0,
  144856. "type": "SB_DFFSR",
  144857. "parameters": {
  144858. },
  144859. "attributes": {
  144860. "module_not_derived": "00000000000000000000000000000001",
  144861. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:294.2-302.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  144862. },
  144863. "port_directions": {
  144864. "C": "input",
  144865. "D": "input",
  144866. "Q": "output",
  144867. "R": "input"
  144868. },
  144869. "connections": {
  144870. "C": [ 42 ],
  144871. "D": [ 5977 ],
  144872. "Q": [ 5966 ],
  144873. "R": [ 127 ]
  144874. }
  144875. },
  144876. "rgb_I.wb_ack_SB_DFFSR_Q_D_SB_LUT4_O": {
  144877. "hide_name": 0,
  144878. "type": "SB_LUT4",
  144879. "parameters": {
  144880. "LUT_INIT": "1111000000000000"
  144881. },
  144882. "attributes": {
  144883. "module_not_derived": "00000000000000000000000000000001",
  144884. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  144885. },
  144886. "port_directions": {
  144887. "I0": "input",
  144888. "I1": "input",
  144889. "I2": "input",
  144890. "I3": "input",
  144891. "O": "output"
  144892. },
  144893. "connections": {
  144894. "I0": [ "0" ],
  144895. "I1": [ "0" ],
  144896. "I2": [ 687 ],
  144897. "I3": [ 5978 ],
  144898. "O": [ 5977 ]
  144899. }
  144900. },
  144901. "rgb_I.wb_ack_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  144902. "hide_name": 0,
  144903. "type": "SB_LUT4",
  144904. "parameters": {
  144905. "LUT_INIT": "1111000000000000"
  144906. },
  144907. "attributes": {
  144908. "module_not_derived": "00000000000000000000000000000001",
  144909. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  144910. },
  144911. "port_directions": {
  144912. "I0": "input",
  144913. "I1": "input",
  144914. "I2": "input",
  144915. "I3": "input",
  144916. "O": "output"
  144917. },
  144918. "connections": {
  144919. "I0": [ "0" ],
  144920. "I1": [ "0" ],
  144921. "I2": [ 689 ],
  144922. "I3": [ 5632 ],
  144923. "O": [ 5978 ]
  144924. }
  144925. },
  144926. "rgb_I.wb_ack_SB_LUT4_I0": {
  144927. "hide_name": 0,
  144928. "type": "SB_LUT4",
  144929. "parameters": {
  144930. "LUT_INIT": "1111111111111110"
  144931. },
  144932. "attributes": {
  144933. "module_not_derived": "00000000000000000000000000000001",
  144934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  144935. },
  144936. "port_directions": {
  144937. "I0": "input",
  144938. "I1": "input",
  144939. "I2": "input",
  144940. "I3": "input",
  144941. "O": "output"
  144942. },
  144943. "connections": {
  144944. "I0": [ 5966 ],
  144945. "I1": [ 5979 ],
  144946. "I2": [ 5980 ],
  144947. "I3": [ 5415 ],
  144948. "O": [ 938 ]
  144949. }
  144950. },
  144951. "rgb_I.wb_ack_SB_LUT4_I2": {
  144952. "hide_name": 0,
  144953. "type": "SB_LUT4",
  144954. "parameters": {
  144955. "LUT_INIT": "0011000000000000"
  144956. },
  144957. "attributes": {
  144958. "module_not_derived": "00000000000000000000000000000001",
  144959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  144960. },
  144961. "port_directions": {
  144962. "I0": "input",
  144963. "I1": "input",
  144964. "I2": "input",
  144965. "I3": "input",
  144966. "O": "output"
  144967. },
  144968. "connections": {
  144969. "I0": [ "0" ],
  144970. "I1": [ 697 ],
  144971. "I2": [ 5966 ],
  144972. "I3": [ 469 ],
  144973. "O": [ 5975 ]
  144974. }
  144975. },
  144976. "sys_mgr_I.crg_I.clk_div_SB_DFFR_Q": {
  144977. "hide_name": 0,
  144978. "type": "SB_DFFR",
  144979. "parameters": {
  144980. },
  144981. "attributes": {
  144982. "module_not_derived": "00000000000000000000000000000001",
  144983. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:74.2-78.36|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  144984. },
  144985. "port_directions": {
  144986. "C": "input",
  144987. "D": "input",
  144988. "Q": "output",
  144989. "R": "input"
  144990. },
  144991. "connections": {
  144992. "C": [ 5666 ],
  144993. "D": [ 5981 ],
  144994. "Q": [ 5982 ],
  144995. "R": [ 5983 ]
  144996. }
  144997. },
  144998. "sys_mgr_I.crg_I.clk_div_SB_LUT4_I1": {
  144999. "hide_name": 0,
  145000. "type": "SB_LUT4",
  145001. "parameters": {
  145002. "LUT_INIT": "1100110000111100"
  145003. },
  145004. "attributes": {
  145005. "module_not_derived": "00000000000000000000000000000001",
  145006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  145007. },
  145008. "port_directions": {
  145009. "I0": "input",
  145010. "I1": "input",
  145011. "I2": "input",
  145012. "I3": "input",
  145013. "O": "output"
  145014. },
  145015. "connections": {
  145016. "I0": [ "0" ],
  145017. "I1": [ 5982 ],
  145018. "I2": [ 5984 ],
  145019. "I3": [ 5985 ],
  145020. "O": [ 5981 ]
  145021. }
  145022. },
  145023. "sys_mgr_I.crg_I.clk_div_SB_LUT4_I1_I2_SB_DFFR_Q": {
  145024. "hide_name": 0,
  145025. "type": "SB_DFFR",
  145026. "parameters": {
  145027. },
  145028. "attributes": {
  145029. "module_not_derived": "00000000000000000000000000000001",
  145030. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:74.2-78.36|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  145031. },
  145032. "port_directions": {
  145033. "C": "input",
  145034. "D": "input",
  145035. "Q": "output",
  145036. "R": "input"
  145037. },
  145038. "connections": {
  145039. "C": [ 5666 ],
  145040. "D": [ 5986 ],
  145041. "Q": [ 5984 ],
  145042. "R": [ 5983 ]
  145043. }
  145044. },
  145045. "sys_mgr_I.crg_I.clk_div_SB_LUT4_I1_I2_SB_LUT4_I2": {
  145046. "hide_name": 0,
  145047. "type": "SB_LUT4",
  145048. "parameters": {
  145049. "LUT_INIT": "1111000000001111"
  145050. },
  145051. "attributes": {
  145052. "module_not_derived": "00000000000000000000000000000001",
  145053. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  145054. },
  145055. "port_directions": {
  145056. "I0": "input",
  145057. "I1": "input",
  145058. "I2": "input",
  145059. "I3": "input",
  145060. "O": "output"
  145061. },
  145062. "connections": {
  145063. "I0": [ "0" ],
  145064. "I1": [ "0" ],
  145065. "I2": [ 5984 ],
  145066. "I3": [ 5985 ],
  145067. "O": [ 5986 ]
  145068. }
  145069. },
  145070. "sys_mgr_I.crg_I.gbuf_1x_I": {
  145071. "hide_name": 0,
  145072. "type": "SB_GB",
  145073. "parameters": {
  145074. },
  145075. "attributes": {
  145076. "BEL": "X12/Y0/gb",
  145077. "hdlname": "sys_mgr_I crg_I gbuf_1x_I",
  145078. "module_not_derived": "00000000000000000000000000000001",
  145079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:94.8-97.3"
  145080. },
  145081. "port_directions": {
  145082. "GLOBAL_BUFFER_OUTPUT": "output",
  145083. "USER_SIGNAL_TO_GLOBAL_BUFFER": "input"
  145084. },
  145085. "connections": {
  145086. "GLOBAL_BUFFER_OUTPUT": [ 42 ],
  145087. "USER_SIGNAL_TO_GLOBAL_BUFFER": [ 5982 ]
  145088. }
  145089. },
  145090. "sys_mgr_I.crg_I.gbuf_rst_I": {
  145091. "hide_name": 0,
  145092. "type": "SB_GB",
  145093. "parameters": {
  145094. },
  145095. "attributes": {
  145096. "hdlname": "sys_mgr_I crg_I gbuf_rst_I",
  145097. "module_not_derived": "00000000000000000000000000000001",
  145098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:64.8-67.3"
  145099. },
  145100. "port_directions": {
  145101. "GLOBAL_BUFFER_OUTPUT": "output",
  145102. "USER_SIGNAL_TO_GLOBAL_BUFFER": "input"
  145103. },
  145104. "connections": {
  145105. "GLOBAL_BUFFER_OUTPUT": [ 127 ],
  145106. "USER_SIGNAL_TO_GLOBAL_BUFFER": [ 5987 ]
  145107. }
  145108. },
  145109. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3": {
  145110. "hide_name": 0,
  145111. "type": "SB_LUT4",
  145112. "parameters": {
  145113. "LUT_INIT": "0000000011111111"
  145114. },
  145115. "attributes": {
  145116. "module_not_derived": "00000000000000000000000000000001",
  145117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  145118. },
  145119. "port_directions": {
  145120. "I0": "input",
  145121. "I1": "input",
  145122. "I2": "input",
  145123. "I3": "input",
  145124. "O": "output"
  145125. },
  145126. "connections": {
  145127. "I0": [ "0" ],
  145128. "I1": [ "0" ],
  145129. "I2": [ "0" ],
  145130. "I3": [ 5988 ],
  145131. "O": [ 5983 ]
  145132. }
  145133. },
  145134. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R": {
  145135. "hide_name": 0,
  145136. "type": "SB_DFFR",
  145137. "parameters": {
  145138. },
  145139. "attributes": {
  145140. "module_not_derived": "00000000000000000000000000000001",
  145141. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  145142. },
  145143. "port_directions": {
  145144. "C": "input",
  145145. "D": "input",
  145146. "Q": "output",
  145147. "R": "input"
  145148. },
  145149. "connections": {
  145150. "C": [ 5666 ],
  145151. "D": [ 5989 ],
  145152. "Q": [ 5990 ],
  145153. "R": [ 5983 ]
  145154. }
  145155. },
  145156. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_1": {
  145157. "hide_name": 0,
  145158. "type": "SB_DFFR",
  145159. "parameters": {
  145160. },
  145161. "attributes": {
  145162. "module_not_derived": "00000000000000000000000000000001",
  145163. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  145164. },
  145165. "port_directions": {
  145166. "C": "input",
  145167. "D": "input",
  145168. "Q": "output",
  145169. "R": "input"
  145170. },
  145171. "connections": {
  145172. "C": [ 5666 ],
  145173. "D": [ 5991 ],
  145174. "Q": [ 5992 ],
  145175. "R": [ 5983 ]
  145176. }
  145177. },
  145178. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_2": {
  145179. "hide_name": 0,
  145180. "type": "SB_DFFR",
  145181. "parameters": {
  145182. },
  145183. "attributes": {
  145184. "module_not_derived": "00000000000000000000000000000001",
  145185. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  145186. },
  145187. "port_directions": {
  145188. "C": "input",
  145189. "D": "input",
  145190. "Q": "output",
  145191. "R": "input"
  145192. },
  145193. "connections": {
  145194. "C": [ 5666 ],
  145195. "D": [ 5993 ],
  145196. "Q": [ 5994 ],
  145197. "R": [ 5983 ]
  145198. }
  145199. },
  145200. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_D_SB_LUT4_O": {
  145201. "hide_name": 0,
  145202. "type": "SB_LUT4",
  145203. "parameters": {
  145204. "LUT_INIT": "0100111100001111"
  145205. },
  145206. "attributes": {
  145207. "module_not_derived": "00000000000000000000000000000001",
  145208. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  145209. },
  145210. "port_directions": {
  145211. "I0": "input",
  145212. "I1": "input",
  145213. "I2": "input",
  145214. "I3": "input",
  145215. "O": "output"
  145216. },
  145217. "connections": {
  145218. "I0": [ 5985 ],
  145219. "I1": [ 5990 ],
  145220. "I2": [ 5994 ],
  145221. "I3": [ 5992 ],
  145222. "O": [ 5993 ]
  145223. }
  145224. },
  145225. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_D_SB_LUT4_O_1": {
  145226. "hide_name": 0,
  145227. "type": "SB_LUT4",
  145228. "parameters": {
  145229. "LUT_INIT": "0111110011001100"
  145230. },
  145231. "attributes": {
  145232. "module_not_derived": "00000000000000000000000000000001",
  145233. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  145234. },
  145235. "port_directions": {
  145236. "I0": "input",
  145237. "I1": "input",
  145238. "I2": "input",
  145239. "I3": "input",
  145240. "O": "output"
  145241. },
  145242. "connections": {
  145243. "I0": [ 5985 ],
  145244. "I1": [ 5990 ],
  145245. "I2": [ 5994 ],
  145246. "I3": [ 5992 ],
  145247. "O": [ 5989 ]
  145248. }
  145249. },
  145250. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_D_SB_LUT4_O_2": {
  145251. "hide_name": 0,
  145252. "type": "SB_LUT4",
  145253. "parameters": {
  145254. "LUT_INIT": "0100111111110000"
  145255. },
  145256. "attributes": {
  145257. "module_not_derived": "00000000000000000000000000000001",
  145258. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  145259. },
  145260. "port_directions": {
  145261. "I0": "input",
  145262. "I1": "input",
  145263. "I2": "input",
  145264. "I3": "input",
  145265. "O": "output"
  145266. },
  145267. "connections": {
  145268. "I0": [ 5985 ],
  145269. "I1": [ 5990 ],
  145270. "I2": [ 5994 ],
  145271. "I3": [ 5992 ],
  145272. "O": [ 5991 ]
  145273. }
  145274. },
  145275. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFS_S": {
  145276. "hide_name": 0,
  145277. "type": "SB_DFFS",
  145278. "parameters": {
  145279. },
  145280. "attributes": {
  145281. "module_not_derived": "00000000000000000000000000000001",
  145282. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  145283. },
  145284. "port_directions": {
  145285. "C": "input",
  145286. "D": "input",
  145287. "Q": "output",
  145288. "S": "input"
  145289. },
  145290. "connections": {
  145291. "C": [ 5666 ],
  145292. "D": [ 5995 ],
  145293. "Q": [ 5985 ],
  145294. "S": [ 5983 ]
  145295. }
  145296. },
  145297. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFS_S_D_SB_LUT4_O": {
  145298. "hide_name": 0,
  145299. "type": "SB_LUT4",
  145300. "parameters": {
  145301. "LUT_INIT": "0010101010101010"
  145302. },
  145303. "attributes": {
  145304. "module_not_derived": "00000000000000000000000000000001",
  145305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  145306. },
  145307. "port_directions": {
  145308. "I0": "input",
  145309. "I1": "input",
  145310. "I2": "input",
  145311. "I3": "input",
  145312. "O": "output"
  145313. },
  145314. "connections": {
  145315. "I0": [ 5985 ],
  145316. "I1": [ 5990 ],
  145317. "I2": [ 5994 ],
  145318. "I3": [ 5992 ],
  145319. "O": [ 5995 ]
  145320. }
  145321. },
  145322. "sys_mgr_I.crg_I.rst_i_SB_DFFS_Q": {
  145323. "hide_name": 0,
  145324. "type": "SB_DFFS",
  145325. "parameters": {
  145326. },
  145327. "attributes": {
  145328. "module_not_derived": "00000000000000000000000000000001",
  145329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:57.2-61.31|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  145330. },
  145331. "port_directions": {
  145332. "C": "input",
  145333. "D": "input",
  145334. "Q": "output",
  145335. "S": "input"
  145336. },
  145337. "connections": {
  145338. "C": [ 5666 ],
  145339. "D": [ 5996 ],
  145340. "Q": [ 5987 ],
  145341. "S": [ 5983 ]
  145342. }
  145343. },
  145344. "sys_mgr_I.crg_I.rst_i_SB_DFFS_Q_D_SB_LUT4_O": {
  145345. "hide_name": 0,
  145346. "type": "SB_LUT4",
  145347. "parameters": {
  145348. "LUT_INIT": "1011111111111111"
  145349. },
  145350. "attributes": {
  145351. "module_not_derived": "00000000000000000000000000000001",
  145352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  145353. },
  145354. "port_directions": {
  145355. "I0": "input",
  145356. "I1": "input",
  145357. "I2": "input",
  145358. "I3": "input",
  145359. "O": "output"
  145360. },
  145361. "connections": {
  145362. "I0": [ 5985 ],
  145363. "I1": [ 5990 ],
  145364. "I2": [ 5994 ],
  145365. "I3": [ 5992 ],
  145366. "O": [ 5996 ]
  145367. }
  145368. },
  145369. "sys_mgr_I.pll_I": {
  145370. "hide_name": 0,
  145371. "type": "SB_PLL40_2F_PAD",
  145372. "parameters": {
  145373. "DELAY_ADJUSTMENT_MODE_RELATIVE": "DYNAMIC",
  145374. "DIVF": "1000010",
  145375. "DIVQ": "011",
  145376. "DIVR": "0000",
  145377. "FDA_RELATIVE": "00000000000000000000000000001111",
  145378. "FEEDBACK_PATH": "SIMPLE",
  145379. "FILTER_RANGE": "001",
  145380. "PLLOUT_SELECT_PORTA": "GENCLK",
  145381. "PLLOUT_SELECT_PORTB": "GENCLK",
  145382. "SHIFTREG_DIV_MODE": "00000000000000000000000000000000"
  145383. },
  145384. "attributes": {
  145385. "hdlname": "sys_mgr_I pll_I",
  145386. "module_not_derived": "00000000000000000000000000000001",
  145387. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:33.4-40.3"
  145388. },
  145389. "port_directions": {
  145390. "DYNAMICDELAY": "input",
  145391. "LOCK": "output",
  145392. "PACKAGEPIN": "input",
  145393. "PLLOUTGLOBALA": "output",
  145394. "PLLOUTGLOBALB": "output",
  145395. "RESETB": "input"
  145396. },
  145397. "connections": {
  145398. "DYNAMICDELAY": [ "0", "0", "0", "0", "0", "0", "0", "0" ],
  145399. "LOCK": [ 5988 ],
  145400. "PACKAGEPIN": [ 31 ],
  145401. "PLLOUTGLOBALA": [ ],
  145402. "PLLOUTGLOBALB": [ 5666 ],
  145403. "RESETB": [ "1" ]
  145404. }
  145405. },
  145406. "sys_mgr_I.sync_96m_I.ff_cnt0_I.d_SB_LUT4_O": {
  145407. "hide_name": 0,
  145408. "type": "SB_LUT4",
  145409. "parameters": {
  145410. "LUT_INIT": "0000111111110000"
  145411. },
  145412. "attributes": {
  145413. "module_not_derived": "00000000000000000000000000000001",
  145414. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  145415. },
  145416. "port_directions": {
  145417. "I0": "input",
  145418. "I1": "input",
  145419. "I2": "input",
  145420. "I3": "input",
  145421. "O": "output"
  145422. },
  145423. "connections": {
  145424. "I0": [ "0" ],
  145425. "I1": [ "0" ],
  145426. "I2": [ 5997 ],
  145427. "I3": [ 5998 ],
  145428. "O": [ 5999 ]
  145429. }
  145430. },
  145431. "sys_mgr_I.sync_96m_I.ff_cnt0_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145432. "hide_name": 0,
  145433. "type": "SB_DFFR",
  145434. "parameters": {
  145435. },
  145436. "attributes": {
  145437. "BEL": "X20/Y4/lc1",
  145438. "SERDES_ATTR": " ",
  145439. "SERDES_GRP": "11111111111111111111111111111111",
  145440. "dont_touch": "00000000000000000000000000000001",
  145441. "hdlname": "sys_mgr_I sync_96m_I ff_cnt0_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145442. "keep": "00000000000000000000000000000001",
  145443. "module_not_derived": "00000000000000000000000000000001",
  145444. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145445. },
  145446. "port_directions": {
  145447. "C": "input",
  145448. "D": "input",
  145449. "Q": "output",
  145450. "R": "input"
  145451. },
  145452. "connections": {
  145453. "C": [ 5666 ],
  145454. "D": [ 5999 ],
  145455. "Q": [ 5997 ],
  145456. "R": [ 127 ]
  145457. }
  145458. },
  145459. "sys_mgr_I.sync_96m_I.ff_cnt1_I.d_SB_LUT4_O": {
  145460. "hide_name": 0,
  145461. "type": "SB_LUT4",
  145462. "parameters": {
  145463. "LUT_INIT": "0011110011001100"
  145464. },
  145465. "attributes": {
  145466. "module_not_derived": "00000000000000000000000000000001",
  145467. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  145468. },
  145469. "port_directions": {
  145470. "I0": "input",
  145471. "I1": "input",
  145472. "I2": "input",
  145473. "I3": "input",
  145474. "O": "output"
  145475. },
  145476. "connections": {
  145477. "I0": [ "0" ],
  145478. "I1": [ 6000 ],
  145479. "I2": [ 5997 ],
  145480. "I3": [ 5998 ],
  145481. "O": [ 6001 ]
  145482. }
  145483. },
  145484. "sys_mgr_I.sync_96m_I.ff_cnt1_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145485. "hide_name": 0,
  145486. "type": "SB_DFFR",
  145487. "parameters": {
  145488. },
  145489. "attributes": {
  145490. "BEL": "X20/Y4/lc2",
  145491. "SERDES_ATTR": " ",
  145492. "SERDES_GRP": "11111111111111111111111111111111",
  145493. "dont_touch": "00000000000000000000000000000001",
  145494. "hdlname": "sys_mgr_I sync_96m_I ff_cnt1_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145495. "keep": "00000000000000000000000000000001",
  145496. "module_not_derived": "00000000000000000000000000000001",
  145497. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145498. },
  145499. "port_directions": {
  145500. "C": "input",
  145501. "D": "input",
  145502. "Q": "output",
  145503. "R": "input"
  145504. },
  145505. "connections": {
  145506. "C": [ 5666 ],
  145507. "D": [ 6001 ],
  145508. "Q": [ 6000 ],
  145509. "R": [ 127 ]
  145510. }
  145511. },
  145512. "sys_mgr_I.sync_96m_I.ff_edge0_I.d_SB_LUT4_O": {
  145513. "hide_name": 0,
  145514. "type": "SB_LUT4",
  145515. "parameters": {
  145516. "LUT_INIT": "1100110011111100"
  145517. },
  145518. "attributes": {
  145519. "module_not_derived": "00000000000000000000000000000001",
  145520. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  145521. },
  145522. "port_directions": {
  145523. "I0": "input",
  145524. "I1": "input",
  145525. "I2": "input",
  145526. "I3": "input",
  145527. "O": "output"
  145528. },
  145529. "connections": {
  145530. "I0": [ "0" ],
  145531. "I1": [ 6002 ],
  145532. "I2": [ 6003 ],
  145533. "I3": [ 6004 ],
  145534. "O": [ 6005 ]
  145535. }
  145536. },
  145537. "sys_mgr_I.sync_96m_I.ff_edge0_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145538. "hide_name": 0,
  145539. "type": "SB_DFFR",
  145540. "parameters": {
  145541. },
  145542. "attributes": {
  145543. "BEL": "X20/Y4/lc5",
  145544. "SERDES_ATTR": " ",
  145545. "SERDES_GRP": "11111111111111111111111111111111",
  145546. "dont_touch": "00000000000000000000000000000001",
  145547. "hdlname": "sys_mgr_I sync_96m_I ff_edge0_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145548. "keep": "00000000000000000000000000000001",
  145549. "module_not_derived": "00000000000000000000000000000001",
  145550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145551. },
  145552. "port_directions": {
  145553. "C": "input",
  145554. "D": "input",
  145555. "Q": "output",
  145556. "R": "input"
  145557. },
  145558. "connections": {
  145559. "C": [ 5666 ],
  145560. "D": [ 6005 ],
  145561. "Q": [ 6002 ],
  145562. "R": [ 127 ]
  145563. }
  145564. },
  145565. "sys_mgr_I.sync_96m_I.ff_edge1_I.d_SB_LUT4_O": {
  145566. "hide_name": 0,
  145567. "type": "SB_LUT4",
  145568. "parameters": {
  145569. "LUT_INIT": "1010111010101010"
  145570. },
  145571. "attributes": {
  145572. "module_not_derived": "00000000000000000000000000000001",
  145573. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  145574. },
  145575. "port_directions": {
  145576. "I0": "input",
  145577. "I1": "input",
  145578. "I2": "input",
  145579. "I3": "input",
  145580. "O": "output"
  145581. },
  145582. "connections": {
  145583. "I0": [ 5998 ],
  145584. "I1": [ 6002 ],
  145585. "I2": [ 6003 ],
  145586. "I3": [ 6004 ],
  145587. "O": [ 6006 ]
  145588. }
  145589. },
  145590. "sys_mgr_I.sync_96m_I.ff_edge1_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145591. "hide_name": 0,
  145592. "type": "SB_DFFR",
  145593. "parameters": {
  145594. },
  145595. "attributes": {
  145596. "BEL": "X20/Y4/lc4",
  145597. "SERDES_ATTR": " ",
  145598. "SERDES_GRP": "11111111111111111111111111111111",
  145599. "dont_touch": "00000000000000000000000000000001",
  145600. "hdlname": "sys_mgr_I sync_96m_I ff_edge1_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145601. "keep": "00000000000000000000000000000001",
  145602. "module_not_derived": "00000000000000000000000000000001",
  145603. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145604. },
  145605. "port_directions": {
  145606. "C": "input",
  145607. "D": "input",
  145608. "Q": "output",
  145609. "R": "input"
  145610. },
  145611. "connections": {
  145612. "C": [ 5666 ],
  145613. "D": [ 6006 ],
  145614. "Q": [ 5998 ],
  145615. "R": [ 127 ]
  145616. }
  145617. },
  145618. "sys_mgr_I.sync_96m_I.ff_samp0_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145619. "hide_name": 0,
  145620. "type": "SB_DFFR",
  145621. "parameters": {
  145622. },
  145623. "attributes": {
  145624. "BEL": "X20/Y4/lc7",
  145625. "SERDES_ATTR": " ",
  145626. "SERDES_GRP": "11111111111111111111111111111111",
  145627. "dont_touch": "00000000000000000000000000000001",
  145628. "hdlname": "sys_mgr_I sync_96m_I ff_samp0_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145629. "keep": "00000000000000000000000000000001",
  145630. "module_not_derived": "00000000000000000000000000000001",
  145631. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145632. },
  145633. "port_directions": {
  145634. "C": "input",
  145635. "D": "input",
  145636. "Q": "output",
  145637. "R": "input"
  145638. },
  145639. "connections": {
  145640. "C": [ 5666 ],
  145641. "D": [ 42 ],
  145642. "Q": [ 6004 ],
  145643. "R": [ 127 ]
  145644. }
  145645. },
  145646. "sys_mgr_I.sync_96m_I.ff_samp1_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145647. "hide_name": 0,
  145648. "type": "SB_DFFR",
  145649. "parameters": {
  145650. },
  145651. "attributes": {
  145652. "BEL": "X20/Y4/lc6",
  145653. "SERDES_ATTR": " ",
  145654. "SERDES_GRP": "11111111111111111111111111111111",
  145655. "dont_touch": "00000000000000000000000000000001",
  145656. "hdlname": "sys_mgr_I sync_96m_I ff_samp1_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145657. "keep": "00000000000000000000000000000001",
  145658. "module_not_derived": "00000000000000000000000000000001",
  145659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145660. },
  145661. "port_directions": {
  145662. "C": "input",
  145663. "D": "input",
  145664. "Q": "output",
  145665. "R": "input"
  145666. },
  145667. "connections": {
  145668. "C": [ 5666 ],
  145669. "D": [ 6004 ],
  145670. "Q": [ 6003 ],
  145671. "R": [ 127 ]
  145672. }
  145673. },
  145674. "sys_mgr_I.sync_96m_I.ff_sync0_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145675. "hide_name": 0,
  145676. "type": "SB_DFFR",
  145677. "parameters": {
  145678. },
  145679. "attributes": {
  145680. "BEL": "X20/Y4/lc0",
  145681. "SERDES_ATTR": " ",
  145682. "SERDES_GRP": "11111111111111111111111111111111",
  145683. "dont_touch": "00000000000000000000000000000001",
  145684. "hdlname": "sys_mgr_I sync_96m_I ff_sync0_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145685. "keep": "00000000000000000000000000000001",
  145686. "module_not_derived": "00000000000000000000000000000001",
  145687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145688. },
  145689. "port_directions": {
  145690. "C": "input",
  145691. "D": "input",
  145692. "Q": "output",
  145693. "R": "input"
  145694. },
  145695. "connections": {
  145696. "C": [ 5666 ],
  145697. "D": [ 6007 ],
  145698. "Q": [ 5672 ],
  145699. "R": [ 127 ]
  145700. }
  145701. },
  145702. "sys_mgr_I.sync_96m_I.ff_sync1_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I": {
  145703. "hide_name": 0,
  145704. "type": "SB_DFFR",
  145705. "parameters": {
  145706. },
  145707. "attributes": {
  145708. "BEL": "X20/Y4/lc3",
  145709. "SERDES_ATTR": " ",
  145710. "SERDES_GRP": "11111111111111111111111111111111",
  145711. "dont_touch": "00000000000000000000000000000001",
  145712. "hdlname": "sys_mgr_I sync_96m_I ff_sync1_I genblk1.genblk1.genblk1.genblk1.genblk1.dff_I",
  145713. "keep": "00000000000000000000000000000001",
  145714. "module_not_derived": "00000000000000000000000000000001",
  145715. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:70.12-75.5"
  145716. },
  145717. "port_directions": {
  145718. "C": "input",
  145719. "D": "input",
  145720. "Q": "output",
  145721. "R": "input"
  145722. },
  145723. "connections": {
  145724. "C": [ 5666 ],
  145725. "D": [ 6008 ],
  145726. "Q": [ 6009 ],
  145727. "R": [ 127 ]
  145728. }
  145729. },
  145730. "sys_mgr_I.sync_96m_I.lut_sync_I[0]": {
  145731. "hide_name": 0,
  145732. "type": "SB_LUT4",
  145733. "parameters": {
  145734. "LUT_INIT": "00000000000000000000010000000000"
  145735. },
  145736. "attributes": {
  145737. "hdlname": "sys_mgr_I sync_96m_I lut_sync_I[0]",
  145738. "module_not_derived": "00000000000000000000000000000001",
  145739. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:116.4-122.3"
  145740. },
  145741. "port_directions": {
  145742. "I0": "input",
  145743. "I1": "input",
  145744. "I2": "input",
  145745. "I3": "input",
  145746. "O": "output"
  145747. },
  145748. "connections": {
  145749. "I0": [ "0" ],
  145750. "I1": [ 5998 ],
  145751. "I2": [ 5997 ],
  145752. "I3": [ 6000 ],
  145753. "O": [ 6007 ]
  145754. }
  145755. },
  145756. "sys_mgr_I.sync_96m_I.lut_sync_I[1]": {
  145757. "hide_name": 0,
  145758. "type": "SB_LUT4",
  145759. "parameters": {
  145760. "LUT_INIT": "00000000000000000000010000000000"
  145761. },
  145762. "attributes": {
  145763. "hdlname": "sys_mgr_I sync_96m_I lut_sync_I[1]",
  145764. "module_not_derived": "00000000000000000000000000000001",
  145765. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:116.4-122.3"
  145766. },
  145767. "port_directions": {
  145768. "I0": "input",
  145769. "I1": "input",
  145770. "I2": "input",
  145771. "I3": "input",
  145772. "O": "output"
  145773. },
  145774. "connections": {
  145775. "I0": [ "0" ],
  145776. "I1": [ 5998 ],
  145777. "I2": [ 5997 ],
  145778. "I3": [ 6000 ],
  145779. "O": [ 6008 ]
  145780. }
  145781. },
  145782. "uart_I.uart_div_SB_DFFE_Q": {
  145783. "hide_name": 0,
  145784. "type": "SB_DFFE",
  145785. "parameters": {
  145786. },
  145787. "attributes": {
  145788. "module_not_derived": "00000000000000000000000000000001",
  145789. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145790. },
  145791. "port_directions": {
  145792. "C": "input",
  145793. "D": "input",
  145794. "E": "input",
  145795. "Q": "output"
  145796. },
  145797. "connections": {
  145798. "C": [ 42 ],
  145799. "D": [ 73 ],
  145800. "E": [ 6010 ],
  145801. "Q": [ 6011 ]
  145802. }
  145803. },
  145804. "uart_I.uart_div_SB_DFFE_Q_1": {
  145805. "hide_name": 0,
  145806. "type": "SB_DFFE",
  145807. "parameters": {
  145808. },
  145809. "attributes": {
  145810. "module_not_derived": "00000000000000000000000000000001",
  145811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145812. },
  145813. "port_directions": {
  145814. "C": "input",
  145815. "D": "input",
  145816. "E": "input",
  145817. "Q": "output"
  145818. },
  145819. "connections": {
  145820. "C": [ 42 ],
  145821. "D": [ 65 ],
  145822. "E": [ 6010 ],
  145823. "Q": [ 6012 ]
  145824. }
  145825. },
  145826. "uart_I.uart_div_SB_DFFE_Q_10": {
  145827. "hide_name": 0,
  145828. "type": "SB_DFFE",
  145829. "parameters": {
  145830. },
  145831. "attributes": {
  145832. "module_not_derived": "00000000000000000000000000000001",
  145833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145834. },
  145835. "port_directions": {
  145836. "C": "input",
  145837. "D": "input",
  145838. "E": "input",
  145839. "Q": "output"
  145840. },
  145841. "connections": {
  145842. "C": [ 42 ],
  145843. "D": [ 68 ],
  145844. "E": [ 6010 ],
  145845. "Q": [ 6013 ]
  145846. }
  145847. },
  145848. "uart_I.uart_div_SB_DFFE_Q_11": {
  145849. "hide_name": 0,
  145850. "type": "SB_DFFE",
  145851. "parameters": {
  145852. },
  145853. "attributes": {
  145854. "module_not_derived": "00000000000000000000000000000001",
  145855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145856. },
  145857. "port_directions": {
  145858. "C": "input",
  145859. "D": "input",
  145860. "E": "input",
  145861. "Q": "output"
  145862. },
  145863. "connections": {
  145864. "C": [ 42 ],
  145865. "D": [ 60 ],
  145866. "E": [ 6010 ],
  145867. "Q": [ 6014 ]
  145868. }
  145869. },
  145870. "uart_I.uart_div_SB_DFFE_Q_2": {
  145871. "hide_name": 0,
  145872. "type": "SB_DFFE",
  145873. "parameters": {
  145874. },
  145875. "attributes": {
  145876. "module_not_derived": "00000000000000000000000000000001",
  145877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145878. },
  145879. "port_directions": {
  145880. "C": "input",
  145881. "D": "input",
  145882. "E": "input",
  145883. "Q": "output"
  145884. },
  145885. "connections": {
  145886. "C": [ 42 ],
  145887. "D": [ 69 ],
  145888. "E": [ 6010 ],
  145889. "Q": [ 6015 ]
  145890. }
  145891. },
  145892. "uart_I.uart_div_SB_DFFE_Q_3": {
  145893. "hide_name": 0,
  145894. "type": "SB_DFFE",
  145895. "parameters": {
  145896. },
  145897. "attributes": {
  145898. "module_not_derived": "00000000000000000000000000000001",
  145899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145900. },
  145901. "port_directions": {
  145902. "C": "input",
  145903. "D": "input",
  145904. "E": "input",
  145905. "Q": "output"
  145906. },
  145907. "connections": {
  145908. "C": [ 42 ],
  145909. "D": [ 61 ],
  145910. "E": [ 6010 ],
  145911. "Q": [ 6016 ]
  145912. }
  145913. },
  145914. "uart_I.uart_div_SB_DFFE_Q_4": {
  145915. "hide_name": 0,
  145916. "type": "SB_DFFE",
  145917. "parameters": {
  145918. },
  145919. "attributes": {
  145920. "module_not_derived": "00000000000000000000000000000001",
  145921. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145922. },
  145923. "port_directions": {
  145924. "C": "input",
  145925. "D": "input",
  145926. "E": "input",
  145927. "Q": "output"
  145928. },
  145929. "connections": {
  145930. "C": [ 42 ],
  145931. "D": [ 74 ],
  145932. "E": [ 6010 ],
  145933. "Q": [ 6017 ]
  145934. }
  145935. },
  145936. "uart_I.uart_div_SB_DFFE_Q_5": {
  145937. "hide_name": 0,
  145938. "type": "SB_DFFE",
  145939. "parameters": {
  145940. },
  145941. "attributes": {
  145942. "module_not_derived": "00000000000000000000000000000001",
  145943. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145944. },
  145945. "port_directions": {
  145946. "C": "input",
  145947. "D": "input",
  145948. "E": "input",
  145949. "Q": "output"
  145950. },
  145951. "connections": {
  145952. "C": [ 42 ],
  145953. "D": [ 66 ],
  145954. "E": [ 6010 ],
  145955. "Q": [ 6018 ]
  145956. }
  145957. },
  145958. "uart_I.uart_div_SB_DFFE_Q_6": {
  145959. "hide_name": 0,
  145960. "type": "SB_DFFE",
  145961. "parameters": {
  145962. },
  145963. "attributes": {
  145964. "module_not_derived": "00000000000000000000000000000001",
  145965. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145966. },
  145967. "port_directions": {
  145968. "C": "input",
  145969. "D": "input",
  145970. "E": "input",
  145971. "Q": "output"
  145972. },
  145973. "connections": {
  145974. "C": [ 42 ],
  145975. "D": [ 70 ],
  145976. "E": [ 6010 ],
  145977. "Q": [ 6019 ]
  145978. }
  145979. },
  145980. "uart_I.uart_div_SB_DFFE_Q_7": {
  145981. "hide_name": 0,
  145982. "type": "SB_DFFE",
  145983. "parameters": {
  145984. },
  145985. "attributes": {
  145986. "module_not_derived": "00000000000000000000000000000001",
  145987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  145988. },
  145989. "port_directions": {
  145990. "C": "input",
  145991. "D": "input",
  145992. "E": "input",
  145993. "Q": "output"
  145994. },
  145995. "connections": {
  145996. "C": [ 42 ],
  145997. "D": [ 62 ],
  145998. "E": [ 6010 ],
  145999. "Q": [ 6020 ]
  146000. }
  146001. },
  146002. "uart_I.uart_div_SB_DFFE_Q_8": {
  146003. "hide_name": 0,
  146004. "type": "SB_DFFE",
  146005. "parameters": {
  146006. },
  146007. "attributes": {
  146008. "module_not_derived": "00000000000000000000000000000001",
  146009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  146010. },
  146011. "port_directions": {
  146012. "C": "input",
  146013. "D": "input",
  146014. "E": "input",
  146015. "Q": "output"
  146016. },
  146017. "connections": {
  146018. "C": [ 42 ],
  146019. "D": [ 72 ],
  146020. "E": [ 6010 ],
  146021. "Q": [ 6021 ]
  146022. }
  146023. },
  146024. "uart_I.uart_div_SB_DFFE_Q_9": {
  146025. "hide_name": 0,
  146026. "type": "SB_DFFE",
  146027. "parameters": {
  146028. },
  146029. "attributes": {
  146030. "module_not_derived": "00000000000000000000000000000001",
  146031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:193.2-195.40|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  146032. },
  146033. "port_directions": {
  146034. "C": "input",
  146035. "D": "input",
  146036. "E": "input",
  146037. "Q": "output"
  146038. },
  146039. "connections": {
  146040. "C": [ 42 ],
  146041. "D": [ 64 ],
  146042. "E": [ 6010 ],
  146043. "Q": [ 6022 ]
  146044. }
  146045. },
  146046. "uart_I.uart_rx_I.bit_cnt_SB_DFFESR_Q": {
  146047. "hide_name": 0,
  146048. "type": "SB_DFFESR",
  146049. "parameters": {
  146050. },
  146051. "attributes": {
  146052. "module_not_derived": "00000000000000000000000000000001",
  146053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:88.2-92.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  146054. },
  146055. "port_directions": {
  146056. "C": "input",
  146057. "D": "input",
  146058. "E": "input",
  146059. "Q": "output",
  146060. "R": "input"
  146061. },
  146062. "connections": {
  146063. "C": [ 42 ],
  146064. "D": [ 6023 ],
  146065. "E": [ 6024 ],
  146066. "Q": [ 6025 ],
  146067. "R": [ 6026 ]
  146068. }
  146069. },
  146070. "uart_I.uart_rx_I.bit_cnt_SB_DFFESR_Q_1": {
  146071. "hide_name": 0,
  146072. "type": "SB_DFFESR",
  146073. "parameters": {
  146074. },
  146075. "attributes": {
  146076. "module_not_derived": "00000000000000000000000000000001",
  146077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:88.2-92.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  146078. },
  146079. "port_directions": {
  146080. "C": "input",
  146081. "D": "input",
  146082. "E": "input",
  146083. "Q": "output",
  146084. "R": "input"
  146085. },
  146086. "connections": {
  146087. "C": [ 42 ],
  146088. "D": [ 6027 ],
  146089. "E": [ 6024 ],
  146090. "Q": [ 6028 ],
  146091. "R": [ 6026 ]
  146092. }
  146093. },
  146094. "uart_I.uart_rx_I.bit_cnt_SB_DFFESR_Q_2": {
  146095. "hide_name": 0,
  146096. "type": "SB_DFFESR",
  146097. "parameters": {
  146098. },
  146099. "attributes": {
  146100. "module_not_derived": "00000000000000000000000000000001",
  146101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:88.2-92.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  146102. },
  146103. "port_directions": {
  146104. "C": "input",
  146105. "D": "input",
  146106. "E": "input",
  146107. "Q": "output",
  146108. "R": "input"
  146109. },
  146110. "connections": {
  146111. "C": [ 42 ],
  146112. "D": [ 6029 ],
  146113. "E": [ 6024 ],
  146114. "Q": [ 6030 ],
  146115. "R": [ 6026 ]
  146116. }
  146117. },
  146118. "uart_I.uart_rx_I.bit_cnt_SB_DFFESR_Q_3": {
  146119. "hide_name": 0,
  146120. "type": "SB_DFFESR",
  146121. "parameters": {
  146122. },
  146123. "attributes": {
  146124. "module_not_derived": "00000000000000000000000000000001",
  146125. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:88.2-92.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  146126. },
  146127. "port_directions": {
  146128. "C": "input",
  146129. "D": "input",
  146130. "E": "input",
  146131. "Q": "output",
  146132. "R": "input"
  146133. },
  146134. "connections": {
  146135. "C": [ 42 ],
  146136. "D": [ 6031 ],
  146137. "E": [ 6024 ],
  146138. "Q": [ 6032 ],
  146139. "R": [ 6026 ]
  146140. }
  146141. },
  146142. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q": {
  146143. "hide_name": 0,
  146144. "type": "SB_DFFESS",
  146145. "parameters": {
  146146. },
  146147. "attributes": {
  146148. "module_not_derived": "00000000000000000000000000000001",
  146149. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:88.2-92.27|/usr/bin/../share/yosys/ice40/ff_map.v:25.66-25.119"
  146150. },
  146151. "port_directions": {
  146152. "C": "input",
  146153. "D": "input",
  146154. "E": "input",
  146155. "Q": "output",
  146156. "S": "input"
  146157. },
  146158. "connections": {
  146159. "C": [ 42 ],
  146160. "D": [ 6033 ],
  146161. "E": [ 6024 ],
  146162. "Q": [ 6034 ],
  146163. "S": [ 6026 ]
  146164. }
  146165. },
  146166. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O": {
  146167. "hide_name": 0,
  146168. "type": "SB_LUT4",
  146169. "parameters": {
  146170. "LUT_INIT": "0110100110010110"
  146171. },
  146172. "attributes": {
  146173. "module_not_derived": "00000000000000000000000000000001",
  146174. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146175. },
  146176. "port_directions": {
  146177. "I0": "input",
  146178. "I1": "input",
  146179. "I2": "input",
  146180. "I3": "input",
  146181. "O": "output"
  146182. },
  146183. "connections": {
  146184. "I0": [ "0" ],
  146185. "I1": [ 6034 ],
  146186. "I2": [ "1" ],
  146187. "I3": [ 6035 ],
  146188. "O": [ 6033 ]
  146189. }
  146190. },
  146191. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_1": {
  146192. "hide_name": 0,
  146193. "type": "SB_LUT4",
  146194. "parameters": {
  146195. "LUT_INIT": "0110100110010110"
  146196. },
  146197. "attributes": {
  146198. "module_not_derived": "00000000000000000000000000000001",
  146199. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146200. },
  146201. "port_directions": {
  146202. "I0": "input",
  146203. "I1": "input",
  146204. "I2": "input",
  146205. "I3": "input",
  146206. "O": "output"
  146207. },
  146208. "connections": {
  146209. "I0": [ "0" ],
  146210. "I1": [ 6025 ],
  146211. "I2": [ "1" ],
  146212. "I3": [ 6036 ],
  146213. "O": [ 6023 ]
  146214. }
  146215. },
  146216. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  146217. "hide_name": 0,
  146218. "type": "SB_CARRY",
  146219. "parameters": {
  146220. },
  146221. "attributes": {
  146222. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  146223. },
  146224. "port_directions": {
  146225. "CI": "input",
  146226. "CO": "output",
  146227. "I0": "input",
  146228. "I1": "input"
  146229. },
  146230. "connections": {
  146231. "CI": [ 6035 ],
  146232. "CO": [ 6036 ],
  146233. "I0": [ 6034 ],
  146234. "I1": [ "1" ]
  146235. }
  146236. },
  146237. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_2": {
  146238. "hide_name": 0,
  146239. "type": "SB_LUT4",
  146240. "parameters": {
  146241. "LUT_INIT": "0110100110010110"
  146242. },
  146243. "attributes": {
  146244. "module_not_derived": "00000000000000000000000000000001",
  146245. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146246. },
  146247. "port_directions": {
  146248. "I0": "input",
  146249. "I1": "input",
  146250. "I2": "input",
  146251. "I3": "input",
  146252. "O": "output"
  146253. },
  146254. "connections": {
  146255. "I0": [ "0" ],
  146256. "I1": [ 6030 ],
  146257. "I2": [ "1" ],
  146258. "I3": [ 6032 ],
  146259. "O": [ 6029 ]
  146260. }
  146261. },
  146262. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_3": {
  146263. "hide_name": 0,
  146264. "type": "SB_LUT4",
  146265. "parameters": {
  146266. "LUT_INIT": "0110100110010110"
  146267. },
  146268. "attributes": {
  146269. "module_not_derived": "00000000000000000000000000000001",
  146270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146271. },
  146272. "port_directions": {
  146273. "I0": "input",
  146274. "I1": "input",
  146275. "I2": "input",
  146276. "I3": "input",
  146277. "O": "output"
  146278. },
  146279. "connections": {
  146280. "I0": [ "0" ],
  146281. "I1": [ 6028 ],
  146282. "I2": [ "1" ],
  146283. "I3": [ 6037 ],
  146284. "O": [ 6027 ]
  146285. }
  146286. },
  146287. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  146288. "hide_name": 0,
  146289. "type": "SB_CARRY",
  146290. "parameters": {
  146291. },
  146292. "attributes": {
  146293. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  146294. },
  146295. "port_directions": {
  146296. "CI": "input",
  146297. "CO": "output",
  146298. "I0": "input",
  146299. "I1": "input"
  146300. },
  146301. "connections": {
  146302. "CI": [ 6032 ],
  146303. "CO": [ 6037 ],
  146304. "I0": [ 6030 ],
  146305. "I1": [ "1" ]
  146306. }
  146307. },
  146308. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_4": {
  146309. "hide_name": 0,
  146310. "type": "SB_LUT4",
  146311. "parameters": {
  146312. "LUT_INIT": "0000000011111111"
  146313. },
  146314. "attributes": {
  146315. "module_not_derived": "00000000000000000000000000000001",
  146316. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  146317. },
  146318. "port_directions": {
  146319. "I0": "input",
  146320. "I1": "input",
  146321. "I2": "input",
  146322. "I3": "input",
  146323. "O": "output"
  146324. },
  146325. "connections": {
  146326. "I0": [ "0" ],
  146327. "I1": [ "0" ],
  146328. "I2": [ "0" ],
  146329. "I3": [ 6032 ],
  146330. "O": [ 6031 ]
  146331. }
  146332. },
  146333. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_I3_SB_CARRY_CO": {
  146334. "hide_name": 0,
  146335. "type": "SB_CARRY",
  146336. "parameters": {
  146337. },
  146338. "attributes": {
  146339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  146340. },
  146341. "port_directions": {
  146342. "CI": "input",
  146343. "CO": "output",
  146344. "I0": "input",
  146345. "I1": "input"
  146346. },
  146347. "connections": {
  146348. "CI": [ 6037 ],
  146349. "CO": [ 6035 ],
  146350. "I0": [ 6028 ],
  146351. "I1": [ "1" ]
  146352. }
  146353. },
  146354. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_E_SB_LUT4_O": {
  146355. "hide_name": 0,
  146356. "type": "SB_LUT4",
  146357. "parameters": {
  146358. "LUT_INIT": "1111000011111111"
  146359. },
  146360. "attributes": {
  146361. "module_not_derived": "00000000000000000000000000000001",
  146362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  146363. },
  146364. "port_directions": {
  146365. "I0": "input",
  146366. "I1": "input",
  146367. "I2": "input",
  146368. "I3": "input",
  146369. "O": "output"
  146370. },
  146371. "connections": {
  146372. "I0": [ "0" ],
  146373. "I1": [ "0" ],
  146374. "I2": [ 6038 ],
  146375. "I3": [ 6039 ],
  146376. "O": [ 6024 ]
  146377. }
  146378. },
  146379. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_S_SB_LUT4_O": {
  146380. "hide_name": 0,
  146381. "type": "SB_LUT4",
  146382. "parameters": {
  146383. "LUT_INIT": "0000000011111111"
  146384. },
  146385. "attributes": {
  146386. "module_not_derived": "00000000000000000000000000000001",
  146387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  146388. },
  146389. "port_directions": {
  146390. "I0": "input",
  146391. "I1": "input",
  146392. "I2": "input",
  146393. "I3": "input",
  146394. "O": "output"
  146395. },
  146396. "connections": {
  146397. "I0": [ "0" ],
  146398. "I1": [ "0" ],
  146399. "I2": [ "0" ],
  146400. "I3": [ 6039 ],
  146401. "O": [ 6026 ]
  146402. }
  146403. },
  146404. "uart_I.uart_rx_I.ce_SB_DFF_Q": {
  146405. "hide_name": 0,
  146406. "type": "SB_DFF",
  146407. "parameters": {
  146408. },
  146409. "attributes": {
  146410. "module_not_derived": "00000000000000000000000000000001",
  146411. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146412. },
  146413. "port_directions": {
  146414. "C": "input",
  146415. "D": "input",
  146416. "Q": "output"
  146417. },
  146418. "connections": {
  146419. "C": [ 42 ],
  146420. "D": [ 6040 ],
  146421. "Q": [ 6038 ]
  146422. }
  146423. },
  146424. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q": {
  146425. "hide_name": 0,
  146426. "type": "SB_DFF",
  146427. "parameters": {
  146428. },
  146429. "attributes": {
  146430. "module_not_derived": "00000000000000000000000000000001",
  146431. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146432. },
  146433. "port_directions": {
  146434. "C": "input",
  146435. "D": "input",
  146436. "Q": "output"
  146437. },
  146438. "connections": {
  146439. "C": [ 42 ],
  146440. "D": [ 6041 ],
  146441. "Q": [ 6042 ]
  146442. }
  146443. },
  146444. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_1": {
  146445. "hide_name": 0,
  146446. "type": "SB_DFF",
  146447. "parameters": {
  146448. },
  146449. "attributes": {
  146450. "module_not_derived": "00000000000000000000000000000001",
  146451. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146452. },
  146453. "port_directions": {
  146454. "C": "input",
  146455. "D": "input",
  146456. "Q": "output"
  146457. },
  146458. "connections": {
  146459. "C": [ 42 ],
  146460. "D": [ 6043 ],
  146461. "Q": [ 6044 ]
  146462. }
  146463. },
  146464. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_10": {
  146465. "hide_name": 0,
  146466. "type": "SB_DFF",
  146467. "parameters": {
  146468. },
  146469. "attributes": {
  146470. "module_not_derived": "00000000000000000000000000000001",
  146471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146472. },
  146473. "port_directions": {
  146474. "C": "input",
  146475. "D": "input",
  146476. "Q": "output"
  146477. },
  146478. "connections": {
  146479. "C": [ 42 ],
  146480. "D": [ 6045 ],
  146481. "Q": [ 6046 ]
  146482. }
  146483. },
  146484. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_11": {
  146485. "hide_name": 0,
  146486. "type": "SB_DFF",
  146487. "parameters": {
  146488. },
  146489. "attributes": {
  146490. "module_not_derived": "00000000000000000000000000000001",
  146491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146492. },
  146493. "port_directions": {
  146494. "C": "input",
  146495. "D": "input",
  146496. "Q": "output"
  146497. },
  146498. "connections": {
  146499. "C": [ 42 ],
  146500. "D": [ 6047 ],
  146501. "Q": [ 6048 ]
  146502. }
  146503. },
  146504. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_2": {
  146505. "hide_name": 0,
  146506. "type": "SB_DFF",
  146507. "parameters": {
  146508. },
  146509. "attributes": {
  146510. "module_not_derived": "00000000000000000000000000000001",
  146511. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146512. },
  146513. "port_directions": {
  146514. "C": "input",
  146515. "D": "input",
  146516. "Q": "output"
  146517. },
  146518. "connections": {
  146519. "C": [ 42 ],
  146520. "D": [ 6049 ],
  146521. "Q": [ 6050 ]
  146522. }
  146523. },
  146524. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_3": {
  146525. "hide_name": 0,
  146526. "type": "SB_DFF",
  146527. "parameters": {
  146528. },
  146529. "attributes": {
  146530. "module_not_derived": "00000000000000000000000000000001",
  146531. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146532. },
  146533. "port_directions": {
  146534. "C": "input",
  146535. "D": "input",
  146536. "Q": "output"
  146537. },
  146538. "connections": {
  146539. "C": [ 42 ],
  146540. "D": [ 6051 ],
  146541. "Q": [ 6052 ]
  146542. }
  146543. },
  146544. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_4": {
  146545. "hide_name": 0,
  146546. "type": "SB_DFF",
  146547. "parameters": {
  146548. },
  146549. "attributes": {
  146550. "module_not_derived": "00000000000000000000000000000001",
  146551. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146552. },
  146553. "port_directions": {
  146554. "C": "input",
  146555. "D": "input",
  146556. "Q": "output"
  146557. },
  146558. "connections": {
  146559. "C": [ 42 ],
  146560. "D": [ 6053 ],
  146561. "Q": [ 6054 ]
  146562. }
  146563. },
  146564. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_5": {
  146565. "hide_name": 0,
  146566. "type": "SB_DFF",
  146567. "parameters": {
  146568. },
  146569. "attributes": {
  146570. "module_not_derived": "00000000000000000000000000000001",
  146571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146572. },
  146573. "port_directions": {
  146574. "C": "input",
  146575. "D": "input",
  146576. "Q": "output"
  146577. },
  146578. "connections": {
  146579. "C": [ 42 ],
  146580. "D": [ 6055 ],
  146581. "Q": [ 6056 ]
  146582. }
  146583. },
  146584. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_6": {
  146585. "hide_name": 0,
  146586. "type": "SB_DFF",
  146587. "parameters": {
  146588. },
  146589. "attributes": {
  146590. "module_not_derived": "00000000000000000000000000000001",
  146591. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146592. },
  146593. "port_directions": {
  146594. "C": "input",
  146595. "D": "input",
  146596. "Q": "output"
  146597. },
  146598. "connections": {
  146599. "C": [ 42 ],
  146600. "D": [ 6057 ],
  146601. "Q": [ 6058 ]
  146602. }
  146603. },
  146604. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_7": {
  146605. "hide_name": 0,
  146606. "type": "SB_DFF",
  146607. "parameters": {
  146608. },
  146609. "attributes": {
  146610. "module_not_derived": "00000000000000000000000000000001",
  146611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146612. },
  146613. "port_directions": {
  146614. "C": "input",
  146615. "D": "input",
  146616. "Q": "output"
  146617. },
  146618. "connections": {
  146619. "C": [ 42 ],
  146620. "D": [ 6059 ],
  146621. "Q": [ 6060 ]
  146622. }
  146623. },
  146624. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_8": {
  146625. "hide_name": 0,
  146626. "type": "SB_DFF",
  146627. "parameters": {
  146628. },
  146629. "attributes": {
  146630. "module_not_derived": "00000000000000000000000000000001",
  146631. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146632. },
  146633. "port_directions": {
  146634. "C": "input",
  146635. "D": "input",
  146636. "Q": "output"
  146637. },
  146638. "connections": {
  146639. "C": [ 42 ],
  146640. "D": [ 6061 ],
  146641. "Q": [ 6062 ]
  146642. }
  146643. },
  146644. "uart_I.uart_rx_I.div_cnt_SB_DFF_Q_9": {
  146645. "hide_name": 0,
  146646. "type": "SB_DFF",
  146647. "parameters": {
  146648. },
  146649. "attributes": {
  146650. "module_not_derived": "00000000000000000000000000000001",
  146651. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:77.2-83.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146652. },
  146653. "port_directions": {
  146654. "C": "input",
  146655. "D": "input",
  146656. "Q": "output"
  146657. },
  146658. "connections": {
  146659. "C": [ 42 ],
  146660. "D": [ 6063 ],
  146661. "Q": [ 6064 ]
  146662. }
  146663. },
  146664. "uart_I.uart_rx_I.genblk1.gf_I.cnt_SB_DFFSS_Q": {
  146665. "hide_name": 0,
  146666. "type": "SB_DFFSS",
  146667. "parameters": {
  146668. },
  146669. "attributes": {
  146670. "module_not_derived": "00000000000000000000000000000001",
  146671. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:70.2-74.26|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  146672. },
  146673. "port_directions": {
  146674. "C": "input",
  146675. "D": "input",
  146676. "Q": "output",
  146677. "S": "input"
  146678. },
  146679. "connections": {
  146680. "C": [ 42 ],
  146681. "D": [ 6065 ],
  146682. "Q": [ 6066 ],
  146683. "S": [ 127 ]
  146684. }
  146685. },
  146686. "uart_I.uart_rx_I.genblk1.gf_I.cnt_SB_DFFSS_Q_1": {
  146687. "hide_name": 0,
  146688. "type": "SB_DFFSS",
  146689. "parameters": {
  146690. },
  146691. "attributes": {
  146692. "module_not_derived": "00000000000000000000000000000001",
  146693. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:70.2-74.26|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  146694. },
  146695. "port_directions": {
  146696. "C": "input",
  146697. "D": "input",
  146698. "Q": "output",
  146699. "S": "input"
  146700. },
  146701. "connections": {
  146702. "C": [ 42 ],
  146703. "D": [ 6067 ],
  146704. "Q": [ 6068 ],
  146705. "S": [ 127 ]
  146706. }
  146707. },
  146708. "uart_I.uart_rx_I.genblk1.gf_I.cnt_SB_DFFSS_Q_1_D_SB_LUT4_O": {
  146709. "hide_name": 0,
  146710. "type": "SB_LUT4",
  146711. "parameters": {
  146712. "LUT_INIT": "1100000011111100"
  146713. },
  146714. "attributes": {
  146715. "module_not_derived": "00000000000000000000000000000001",
  146716. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  146717. },
  146718. "port_directions": {
  146719. "I0": "input",
  146720. "I1": "input",
  146721. "I2": "input",
  146722. "I3": "input",
  146723. "O": "output"
  146724. },
  146725. "connections": {
  146726. "I0": [ "0" ],
  146727. "I1": [ 6069 ],
  146728. "I2": [ 6066 ],
  146729. "I3": [ 6068 ],
  146730. "O": [ 6067 ]
  146731. }
  146732. },
  146733. "uart_I.uart_rx_I.genblk1.gf_I.cnt_SB_DFFSS_Q_D_SB_LUT4_O": {
  146734. "hide_name": 0,
  146735. "type": "SB_LUT4",
  146736. "parameters": {
  146737. "LUT_INIT": "1111110011000000"
  146738. },
  146739. "attributes": {
  146740. "module_not_derived": "00000000000000000000000000000001",
  146741. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  146742. },
  146743. "port_directions": {
  146744. "I0": "input",
  146745. "I1": "input",
  146746. "I2": "input",
  146747. "I3": "input",
  146748. "O": "output"
  146749. },
  146750. "connections": {
  146751. "I0": [ "0" ],
  146752. "I1": [ 6069 ],
  146753. "I2": [ 6066 ],
  146754. "I3": [ 6068 ],
  146755. "O": [ 6065 ]
  146756. }
  146757. },
  146758. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_DFF_Q": {
  146759. "hide_name": 0,
  146760. "type": "SB_DFF",
  146761. "parameters": {
  146762. },
  146763. "attributes": {
  146764. "module_not_derived": "00000000000000000000000000000001",
  146765. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:95.2-104.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  146766. },
  146767. "port_directions": {
  146768. "C": "input",
  146769. "D": "input",
  146770. "Q": "output"
  146771. },
  146772. "connections": {
  146773. "C": [ 42 ],
  146774. "D": [ 6070 ],
  146775. "Q": [ 6071 ]
  146776. }
  146777. },
  146778. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_DFF_Q_D_SB_LUT4_O": {
  146779. "hide_name": 0,
  146780. "type": "SB_LUT4",
  146781. "parameters": {
  146782. "LUT_INIT": "0000000000001100"
  146783. },
  146784. "attributes": {
  146785. "module_not_derived": "00000000000000000000000000000001",
  146786. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  146787. },
  146788. "port_directions": {
  146789. "I0": "input",
  146790. "I1": "input",
  146791. "I2": "input",
  146792. "I3": "input",
  146793. "O": "output"
  146794. },
  146795. "connections": {
  146796. "I0": [ "0" ],
  146797. "I1": [ 6072 ],
  146798. "I2": [ 6066 ],
  146799. "I3": [ 6068 ],
  146800. "O": [ 6070 ]
  146801. }
  146802. },
  146803. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1": {
  146804. "hide_name": 0,
  146805. "type": "SB_LUT4",
  146806. "parameters": {
  146807. "LUT_INIT": "0101111111001100"
  146808. },
  146809. "attributes": {
  146810. "module_not_derived": "00000000000000000000000000000001",
  146811. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146812. },
  146813. "port_directions": {
  146814. "I0": "input",
  146815. "I1": "input",
  146816. "I2": "input",
  146817. "I3": "input",
  146818. "O": "output"
  146819. },
  146820. "connections": {
  146821. "I0": [ 6038 ],
  146822. "I1": [ 6071 ],
  146823. "I2": [ 6025 ],
  146824. "I3": [ 6039 ],
  146825. "O": [ 6073 ]
  146826. }
  146827. },
  146828. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D": {
  146829. "hide_name": 0,
  146830. "type": "SB_DFFR",
  146831. "parameters": {
  146832. },
  146833. "attributes": {
  146834. "module_not_derived": "00000000000000000000000000000001",
  146835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:70.2-74.36|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  146836. },
  146837. "port_directions": {
  146838. "C": "input",
  146839. "D": "input",
  146840. "Q": "output",
  146841. "R": "input"
  146842. },
  146843. "connections": {
  146844. "C": [ 42 ],
  146845. "D": [ 6073 ],
  146846. "Q": [ 6039 ],
  146847. "R": [ 127 ]
  146848. }
  146849. },
  146850. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O": {
  146851. "hide_name": 0,
  146852. "type": "SB_LUT4",
  146853. "parameters": {
  146854. "LUT_INIT": "0110100110010110"
  146855. },
  146856. "attributes": {
  146857. "module_not_derived": "00000000000000000000000000000001",
  146858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146859. },
  146860. "port_directions": {
  146861. "I0": "input",
  146862. "I1": "input",
  146863. "I2": "input",
  146864. "I3": "input",
  146865. "O": "output"
  146866. },
  146867. "connections": {
  146868. "I0": [ "0" ],
  146869. "I1": [ 6042 ],
  146870. "I2": [ "1" ],
  146871. "I3": [ 6074 ],
  146872. "O": [ 6075 ]
  146873. }
  146874. },
  146875. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI": {
  146876. "hide_name": 0,
  146877. "type": "SB_CARRY",
  146878. "parameters": {
  146879. },
  146880. "attributes": {
  146881. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  146882. },
  146883. "port_directions": {
  146884. "CI": "input",
  146885. "CO": "output",
  146886. "I0": "input",
  146887. "I1": "input"
  146888. },
  146889. "connections": {
  146890. "CI": [ 6074 ],
  146891. "CO": [ 6076 ],
  146892. "I0": [ 6042 ],
  146893. "I1": [ "1" ]
  146894. }
  146895. },
  146896. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3": {
  146897. "hide_name": 0,
  146898. "type": "SB_LUT4",
  146899. "parameters": {
  146900. "LUT_INIT": "0000010100100111"
  146901. },
  146902. "attributes": {
  146903. "module_not_derived": "00000000000000000000000000000001",
  146904. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  146905. },
  146906. "port_directions": {
  146907. "I0": "input",
  146908. "I1": "input",
  146909. "I2": "input",
  146910. "I3": "input",
  146911. "O": "output"
  146912. },
  146913. "connections": {
  146914. "I0": [ 6039 ],
  146915. "I1": [ 6038 ],
  146916. "I2": [ 6077 ],
  146917. "I3": [ 6076 ],
  146918. "O": [ 6040 ]
  146919. }
  146920. },
  146921. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_I2_SB_CARRY_CO": {
  146922. "hide_name": 0,
  146923. "type": "SB_CARRY",
  146924. "parameters": {
  146925. },
  146926. "attributes": {
  146927. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  146928. },
  146929. "port_directions": {
  146930. "CI": "input",
  146931. "CO": "output",
  146932. "I0": "input",
  146933. "I1": "input"
  146934. },
  146935. "connections": {
  146936. "CI": [ 6078 ],
  146937. "CO": [ 6077 ],
  146938. "I0": [ 6011 ],
  146939. "I1": [ "1" ]
  146940. }
  146941. },
  146942. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_I2_SB_CARRY_CO_CI_SB_CARRY_CO": {
  146943. "hide_name": 0,
  146944. "type": "SB_CARRY",
  146945. "parameters": {
  146946. },
  146947. "attributes": {
  146948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  146949. },
  146950. "port_directions": {
  146951. "CI": "input",
  146952. "CO": "output",
  146953. "I0": "input",
  146954. "I1": "input"
  146955. },
  146956. "connections": {
  146957. "CI": [ 6079 ],
  146958. "CO": [ 6078 ],
  146959. "I0": [ 6012 ],
  146960. "I1": [ "1" ]
  146961. }
  146962. },
  146963. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O": {
  146964. "hide_name": 0,
  146965. "type": "SB_LUT4",
  146966. "parameters": {
  146967. "LUT_INIT": "1111111100000011"
  146968. },
  146969. "attributes": {
  146970. "module_not_derived": "00000000000000000000000000000001",
  146971. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  146972. },
  146973. "port_directions": {
  146974. "I0": "input",
  146975. "I1": "input",
  146976. "I2": "input",
  146977. "I3": "input",
  146978. "O": "output"
  146979. },
  146980. "connections": {
  146981. "I0": [ "0" ],
  146982. "I1": [ 6039 ],
  146983. "I2": [ 6077 ],
  146984. "I3": [ 6080 ],
  146985. "O": [ 6041 ]
  146986. }
  146987. },
  146988. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_1": {
  146989. "hide_name": 0,
  146990. "type": "SB_LUT4",
  146991. "parameters": {
  146992. "LUT_INIT": "0000001111110011"
  146993. },
  146994. "attributes": {
  146995. "module_not_derived": "00000000000000000000000000000001",
  146996. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  146997. },
  146998. "port_directions": {
  146999. "I0": "input",
  147000. "I1": "input",
  147001. "I2": "input",
  147002. "I3": "input",
  147003. "O": "output"
  147004. },
  147005. "connections": {
  147006. "I0": [ "0" ],
  147007. "I1": [ 6013 ],
  147008. "I2": [ 6039 ],
  147009. "I3": [ 6081 ],
  147010. "O": [ 6047 ]
  147011. }
  147012. },
  147013. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_10": {
  147014. "hide_name": 0,
  147015. "type": "SB_LUT4",
  147016. "parameters": {
  147017. "LUT_INIT": "1111110000001100"
  147018. },
  147019. "attributes": {
  147020. "module_not_derived": "00000000000000000000000000000001",
  147021. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147022. },
  147023. "port_directions": {
  147024. "I0": "input",
  147025. "I1": "input",
  147026. "I2": "input",
  147027. "I3": "input",
  147028. "O": "output"
  147029. },
  147030. "connections": {
  147031. "I0": [ "0" ],
  147032. "I1": [ 6082 ],
  147033. "I2": [ 6039 ],
  147034. "I3": [ 6083 ],
  147035. "O": [ 6045 ]
  147036. }
  147037. },
  147038. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_10_I1_SB_LUT4_O": {
  147039. "hide_name": 0,
  147040. "type": "SB_LUT4",
  147041. "parameters": {
  147042. "LUT_INIT": "0110100110010110"
  147043. },
  147044. "attributes": {
  147045. "module_not_derived": "00000000000000000000000000000001",
  147046. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147047. },
  147048. "port_directions": {
  147049. "I0": "input",
  147050. "I1": "input",
  147051. "I2": "input",
  147052. "I3": "input",
  147053. "O": "output"
  147054. },
  147055. "connections": {
  147056. "I0": [ "0" ],
  147057. "I1": [ 6022 ],
  147058. "I2": [ "1" ],
  147059. "I3": [ 6013 ],
  147060. "O": [ 6082 ]
  147061. }
  147062. },
  147063. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_10_I1_SB_LUT4_O_1": {
  147064. "hide_name": 0,
  147065. "type": "SB_LUT4",
  147066. "parameters": {
  147067. "LUT_INIT": "1111001111000000"
  147068. },
  147069. "attributes": {
  147070. "module_not_derived": "00000000000000000000000000000001",
  147071. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147072. },
  147073. "port_directions": {
  147074. "I0": "input",
  147075. "I1": "input",
  147076. "I2": "input",
  147077. "I3": "input",
  147078. "O": "output"
  147079. },
  147080. "connections": {
  147081. "I0": [ "0" ],
  147082. "I1": [ 6038 ],
  147083. "I2": [ 6013 ],
  147084. "I3": [ 6084 ],
  147085. "O": [ 6083 ]
  147086. }
  147087. },
  147088. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_10_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  147089. "hide_name": 0,
  147090. "type": "SB_LUT4",
  147091. "parameters": {
  147092. "LUT_INIT": "0110100110010110"
  147093. },
  147094. "attributes": {
  147095. "module_not_derived": "00000000000000000000000000000001",
  147096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147097. },
  147098. "port_directions": {
  147099. "I0": "input",
  147100. "I1": "input",
  147101. "I2": "input",
  147102. "I3": "input",
  147103. "O": "output"
  147104. },
  147105. "connections": {
  147106. "I0": [ "0" ],
  147107. "I1": [ 6046 ],
  147108. "I2": [ "1" ],
  147109. "I3": [ 6048 ],
  147110. "O": [ 6084 ]
  147111. }
  147112. },
  147113. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_11": {
  147114. "hide_name": 0,
  147115. "type": "SB_LUT4",
  147116. "parameters": {
  147117. "LUT_INIT": "1111110000110000"
  147118. },
  147119. "attributes": {
  147120. "module_not_derived": "00000000000000000000000000000001",
  147121. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147122. },
  147123. "port_directions": {
  147124. "I0": "input",
  147125. "I1": "input",
  147126. "I2": "input",
  147127. "I3": "input",
  147128. "O": "output"
  147129. },
  147130. "connections": {
  147131. "I0": [ "0" ],
  147132. "I1": [ 6039 ],
  147133. "I2": [ 6085 ],
  147134. "I3": [ 6086 ],
  147135. "O": [ 6043 ]
  147136. }
  147137. },
  147138. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_11_I2_SB_LUT4_O": {
  147139. "hide_name": 0,
  147140. "type": "SB_LUT4",
  147141. "parameters": {
  147142. "LUT_INIT": "0110100110010110"
  147143. },
  147144. "attributes": {
  147145. "module_not_derived": "00000000000000000000000000000001",
  147146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147147. },
  147148. "port_directions": {
  147149. "I0": "input",
  147150. "I1": "input",
  147151. "I2": "input",
  147152. "I3": "input",
  147153. "O": "output"
  147154. },
  147155. "connections": {
  147156. "I0": [ "0" ],
  147157. "I1": [ 6011 ],
  147158. "I2": [ "1" ],
  147159. "I3": [ 6078 ],
  147160. "O": [ 6085 ]
  147161. }
  147162. },
  147163. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_1_I3_SB_LUT4_O": {
  147164. "hide_name": 0,
  147165. "type": "SB_LUT4",
  147166. "parameters": {
  147167. "LUT_INIT": "0011111100001100"
  147168. },
  147169. "attributes": {
  147170. "module_not_derived": "00000000000000000000000000000001",
  147171. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147172. },
  147173. "port_directions": {
  147174. "I0": "input",
  147175. "I1": "input",
  147176. "I2": "input",
  147177. "I3": "input",
  147178. "O": "output"
  147179. },
  147180. "connections": {
  147181. "I0": [ "0" ],
  147182. "I1": [ 6038 ],
  147183. "I2": [ 6014 ],
  147184. "I3": [ 6048 ],
  147185. "O": [ 6081 ]
  147186. }
  147187. },
  147188. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_2": {
  147189. "hide_name": 0,
  147190. "type": "SB_LUT4",
  147191. "parameters": {
  147192. "LUT_INIT": "1111110000110000"
  147193. },
  147194. "attributes": {
  147195. "module_not_derived": "00000000000000000000000000000001",
  147196. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147197. },
  147198. "port_directions": {
  147199. "I0": "input",
  147200. "I1": "input",
  147201. "I2": "input",
  147202. "I3": "input",
  147203. "O": "output"
  147204. },
  147205. "connections": {
  147206. "I0": [ "0" ],
  147207. "I1": [ 6039 ],
  147208. "I2": [ 6087 ],
  147209. "I3": [ 6088 ],
  147210. "O": [ 6049 ]
  147211. }
  147212. },
  147213. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_2_I2_SB_LUT4_O": {
  147214. "hide_name": 0,
  147215. "type": "SB_LUT4",
  147216. "parameters": {
  147217. "LUT_INIT": "0110100110010110"
  147218. },
  147219. "attributes": {
  147220. "module_not_derived": "00000000000000000000000000000001",
  147221. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147222. },
  147223. "port_directions": {
  147224. "I0": "input",
  147225. "I1": "input",
  147226. "I2": "input",
  147227. "I3": "input",
  147228. "O": "output"
  147229. },
  147230. "connections": {
  147231. "I0": [ "0" ],
  147232. "I1": [ 6012 ],
  147233. "I2": [ "1" ],
  147234. "I3": [ 6079 ],
  147235. "O": [ 6087 ]
  147236. }
  147237. },
  147238. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_2_I2_SB_LUT4_O_1": {
  147239. "hide_name": 0,
  147240. "type": "SB_LUT4",
  147241. "parameters": {
  147242. "LUT_INIT": "1111001111000000"
  147243. },
  147244. "attributes": {
  147245. "module_not_derived": "00000000000000000000000000000001",
  147246. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147247. },
  147248. "port_directions": {
  147249. "I0": "input",
  147250. "I1": "input",
  147251. "I2": "input",
  147252. "I3": "input",
  147253. "O": "output"
  147254. },
  147255. "connections": {
  147256. "I0": [ "0" ],
  147257. "I1": [ 6038 ],
  147258. "I2": [ 6015 ],
  147259. "I3": [ 6089 ],
  147260. "O": [ 6088 ]
  147261. }
  147262. },
  147263. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_2_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  147264. "hide_name": 0,
  147265. "type": "SB_CARRY",
  147266. "parameters": {
  147267. },
  147268. "attributes": {
  147269. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147270. },
  147271. "port_directions": {
  147272. "CI": "input",
  147273. "CO": "output",
  147274. "I0": "input",
  147275. "I1": "input"
  147276. },
  147277. "connections": {
  147278. "CI": [ 6090 ],
  147279. "CO": [ 6079 ],
  147280. "I0": [ 6015 ],
  147281. "I1": [ "1" ]
  147282. }
  147283. },
  147284. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3": {
  147285. "hide_name": 0,
  147286. "type": "SB_LUT4",
  147287. "parameters": {
  147288. "LUT_INIT": "1111110000110000"
  147289. },
  147290. "attributes": {
  147291. "module_not_derived": "00000000000000000000000000000001",
  147292. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147293. },
  147294. "port_directions": {
  147295. "I0": "input",
  147296. "I1": "input",
  147297. "I2": "input",
  147298. "I3": "input",
  147299. "O": "output"
  147300. },
  147301. "connections": {
  147302. "I0": [ "0" ],
  147303. "I1": [ 6039 ],
  147304. "I2": [ 6091 ],
  147305. "I3": [ 6092 ],
  147306. "O": [ 6051 ]
  147307. }
  147308. },
  147309. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3_I2_SB_LUT4_O": {
  147310. "hide_name": 0,
  147311. "type": "SB_LUT4",
  147312. "parameters": {
  147313. "LUT_INIT": "0110100110010110"
  147314. },
  147315. "attributes": {
  147316. "module_not_derived": "00000000000000000000000000000001",
  147317. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147318. },
  147319. "port_directions": {
  147320. "I0": "input",
  147321. "I1": "input",
  147322. "I2": "input",
  147323. "I3": "input",
  147324. "O": "output"
  147325. },
  147326. "connections": {
  147327. "I0": [ "0" ],
  147328. "I1": [ 6015 ],
  147329. "I2": [ "1" ],
  147330. "I3": [ 6090 ],
  147331. "O": [ 6091 ]
  147332. }
  147333. },
  147334. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3_I2_SB_LUT4_O_1": {
  147335. "hide_name": 0,
  147336. "type": "SB_LUT4",
  147337. "parameters": {
  147338. "LUT_INIT": "1111001111000000"
  147339. },
  147340. "attributes": {
  147341. "module_not_derived": "00000000000000000000000000000001",
  147342. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147343. },
  147344. "port_directions": {
  147345. "I0": "input",
  147346. "I1": "input",
  147347. "I2": "input",
  147348. "I3": "input",
  147349. "O": "output"
  147350. },
  147351. "connections": {
  147352. "I0": [ "0" ],
  147353. "I1": [ 6038 ],
  147354. "I2": [ 6016 ],
  147355. "I3": [ 6093 ],
  147356. "O": [ 6092 ]
  147357. }
  147358. },
  147359. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  147360. "hide_name": 0,
  147361. "type": "SB_CARRY",
  147362. "parameters": {
  147363. },
  147364. "attributes": {
  147365. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147366. },
  147367. "port_directions": {
  147368. "CI": "input",
  147369. "CO": "output",
  147370. "I0": "input",
  147371. "I1": "input"
  147372. },
  147373. "connections": {
  147374. "CI": [ 6094 ],
  147375. "CO": [ 6090 ],
  147376. "I0": [ 6016 ],
  147377. "I1": [ "1" ]
  147378. }
  147379. },
  147380. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4": {
  147381. "hide_name": 0,
  147382. "type": "SB_LUT4",
  147383. "parameters": {
  147384. "LUT_INIT": "1111110000110000"
  147385. },
  147386. "attributes": {
  147387. "module_not_derived": "00000000000000000000000000000001",
  147388. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147389. },
  147390. "port_directions": {
  147391. "I0": "input",
  147392. "I1": "input",
  147393. "I2": "input",
  147394. "I3": "input",
  147395. "O": "output"
  147396. },
  147397. "connections": {
  147398. "I0": [ "0" ],
  147399. "I1": [ 6039 ],
  147400. "I2": [ 6095 ],
  147401. "I3": [ 6096 ],
  147402. "O": [ 6053 ]
  147403. }
  147404. },
  147405. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2_SB_LUT4_O": {
  147406. "hide_name": 0,
  147407. "type": "SB_LUT4",
  147408. "parameters": {
  147409. "LUT_INIT": "0110100110010110"
  147410. },
  147411. "attributes": {
  147412. "module_not_derived": "00000000000000000000000000000001",
  147413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147414. },
  147415. "port_directions": {
  147416. "I0": "input",
  147417. "I1": "input",
  147418. "I2": "input",
  147419. "I3": "input",
  147420. "O": "output"
  147421. },
  147422. "connections": {
  147423. "I0": [ "0" ],
  147424. "I1": [ 6016 ],
  147425. "I2": [ "1" ],
  147426. "I3": [ 6094 ],
  147427. "O": [ 6095 ]
  147428. }
  147429. },
  147430. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2_SB_LUT4_O_1": {
  147431. "hide_name": 0,
  147432. "type": "SB_LUT4",
  147433. "parameters": {
  147434. "LUT_INIT": "1111001111000000"
  147435. },
  147436. "attributes": {
  147437. "module_not_derived": "00000000000000000000000000000001",
  147438. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147439. },
  147440. "port_directions": {
  147441. "I0": "input",
  147442. "I1": "input",
  147443. "I2": "input",
  147444. "I3": "input",
  147445. "O": "output"
  147446. },
  147447. "connections": {
  147448. "I0": [ "0" ],
  147449. "I1": [ 6038 ],
  147450. "I2": [ 6017 ],
  147451. "I3": [ 6097 ],
  147452. "O": [ 6096 ]
  147453. }
  147454. },
  147455. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  147456. "hide_name": 0,
  147457. "type": "SB_LUT4",
  147458. "parameters": {
  147459. "LUT_INIT": "0110100110010110"
  147460. },
  147461. "attributes": {
  147462. "module_not_derived": "00000000000000000000000000000001",
  147463. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147464. },
  147465. "port_directions": {
  147466. "I0": "input",
  147467. "I1": "input",
  147468. "I2": "input",
  147469. "I3": "input",
  147470. "O": "output"
  147471. },
  147472. "connections": {
  147473. "I0": [ "0" ],
  147474. "I1": [ 6054 ],
  147475. "I2": [ "1" ],
  147476. "I3": [ 6098 ],
  147477. "O": [ 6097 ]
  147478. }
  147479. },
  147480. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  147481. "hide_name": 0,
  147482. "type": "SB_CARRY",
  147483. "parameters": {
  147484. },
  147485. "attributes": {
  147486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147487. },
  147488. "port_directions": {
  147489. "CI": "input",
  147490. "CO": "output",
  147491. "I0": "input",
  147492. "I1": "input"
  147493. },
  147494. "connections": {
  147495. "CI": [ 6099 ],
  147496. "CO": [ 6094 ],
  147497. "I0": [ 6017 ],
  147498. "I1": [ "1" ]
  147499. }
  147500. },
  147501. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5": {
  147502. "hide_name": 0,
  147503. "type": "SB_LUT4",
  147504. "parameters": {
  147505. "LUT_INIT": "1111110000110000"
  147506. },
  147507. "attributes": {
  147508. "module_not_derived": "00000000000000000000000000000001",
  147509. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147510. },
  147511. "port_directions": {
  147512. "I0": "input",
  147513. "I1": "input",
  147514. "I2": "input",
  147515. "I3": "input",
  147516. "O": "output"
  147517. },
  147518. "connections": {
  147519. "I0": [ "0" ],
  147520. "I1": [ 6039 ],
  147521. "I2": [ 6100 ],
  147522. "I3": [ 6101 ],
  147523. "O": [ 6055 ]
  147524. }
  147525. },
  147526. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O": {
  147527. "hide_name": 0,
  147528. "type": "SB_LUT4",
  147529. "parameters": {
  147530. "LUT_INIT": "0110100110010110"
  147531. },
  147532. "attributes": {
  147533. "module_not_derived": "00000000000000000000000000000001",
  147534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147535. },
  147536. "port_directions": {
  147537. "I0": "input",
  147538. "I1": "input",
  147539. "I2": "input",
  147540. "I3": "input",
  147541. "O": "output"
  147542. },
  147543. "connections": {
  147544. "I0": [ "0" ],
  147545. "I1": [ 6017 ],
  147546. "I2": [ "1" ],
  147547. "I3": [ 6099 ],
  147548. "O": [ 6100 ]
  147549. }
  147550. },
  147551. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_1": {
  147552. "hide_name": 0,
  147553. "type": "SB_LUT4",
  147554. "parameters": {
  147555. "LUT_INIT": "1111001111000000"
  147556. },
  147557. "attributes": {
  147558. "module_not_derived": "00000000000000000000000000000001",
  147559. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147560. },
  147561. "port_directions": {
  147562. "I0": "input",
  147563. "I1": "input",
  147564. "I2": "input",
  147565. "I3": "input",
  147566. "O": "output"
  147567. },
  147568. "connections": {
  147569. "I0": [ "0" ],
  147570. "I1": [ 6038 ],
  147571. "I2": [ 6018 ],
  147572. "I3": [ 6102 ],
  147573. "O": [ 6101 ]
  147574. }
  147575. },
  147576. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  147577. "hide_name": 0,
  147578. "type": "SB_LUT4",
  147579. "parameters": {
  147580. "LUT_INIT": "0110100110010110"
  147581. },
  147582. "attributes": {
  147583. "module_not_derived": "00000000000000000000000000000001",
  147584. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147585. },
  147586. "port_directions": {
  147587. "I0": "input",
  147588. "I1": "input",
  147589. "I2": "input",
  147590. "I3": "input",
  147591. "O": "output"
  147592. },
  147593. "connections": {
  147594. "I0": [ "0" ],
  147595. "I1": [ 6056 ],
  147596. "I2": [ "1" ],
  147597. "I3": [ 6103 ],
  147598. "O": [ 6102 ]
  147599. }
  147600. },
  147601. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  147602. "hide_name": 0,
  147603. "type": "SB_CARRY",
  147604. "parameters": {
  147605. },
  147606. "attributes": {
  147607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147608. },
  147609. "port_directions": {
  147610. "CI": "input",
  147611. "CO": "output",
  147612. "I0": "input",
  147613. "I1": "input"
  147614. },
  147615. "connections": {
  147616. "CI": [ 6104 ],
  147617. "CO": [ 6103 ],
  147618. "I0": [ 6058 ],
  147619. "I1": [ "1" ]
  147620. }
  147621. },
  147622. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  147623. "hide_name": 0,
  147624. "type": "SB_CARRY",
  147625. "parameters": {
  147626. },
  147627. "attributes": {
  147628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147629. },
  147630. "port_directions": {
  147631. "CI": "input",
  147632. "CO": "output",
  147633. "I0": "input",
  147634. "I1": "input"
  147635. },
  147636. "connections": {
  147637. "CI": [ 6105 ],
  147638. "CO": [ 6099 ],
  147639. "I0": [ 6018 ],
  147640. "I1": [ "1" ]
  147641. }
  147642. },
  147643. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6": {
  147644. "hide_name": 0,
  147645. "type": "SB_LUT4",
  147646. "parameters": {
  147647. "LUT_INIT": "1111110000110000"
  147648. },
  147649. "attributes": {
  147650. "module_not_derived": "00000000000000000000000000000001",
  147651. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147652. },
  147653. "port_directions": {
  147654. "I0": "input",
  147655. "I1": "input",
  147656. "I2": "input",
  147657. "I3": "input",
  147658. "O": "output"
  147659. },
  147660. "connections": {
  147661. "I0": [ "0" ],
  147662. "I1": [ 6039 ],
  147663. "I2": [ 6106 ],
  147664. "I3": [ 6107 ],
  147665. "O": [ 6057 ]
  147666. }
  147667. },
  147668. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O": {
  147669. "hide_name": 0,
  147670. "type": "SB_LUT4",
  147671. "parameters": {
  147672. "LUT_INIT": "0110100110010110"
  147673. },
  147674. "attributes": {
  147675. "module_not_derived": "00000000000000000000000000000001",
  147676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147677. },
  147678. "port_directions": {
  147679. "I0": "input",
  147680. "I1": "input",
  147681. "I2": "input",
  147682. "I3": "input",
  147683. "O": "output"
  147684. },
  147685. "connections": {
  147686. "I0": [ "0" ],
  147687. "I1": [ 6018 ],
  147688. "I2": [ "1" ],
  147689. "I3": [ 6105 ],
  147690. "O": [ 6106 ]
  147691. }
  147692. },
  147693. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_1": {
  147694. "hide_name": 0,
  147695. "type": "SB_LUT4",
  147696. "parameters": {
  147697. "LUT_INIT": "1111001111000000"
  147698. },
  147699. "attributes": {
  147700. "module_not_derived": "00000000000000000000000000000001",
  147701. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147702. },
  147703. "port_directions": {
  147704. "I0": "input",
  147705. "I1": "input",
  147706. "I2": "input",
  147707. "I3": "input",
  147708. "O": "output"
  147709. },
  147710. "connections": {
  147711. "I0": [ "0" ],
  147712. "I1": [ 6038 ],
  147713. "I2": [ 6019 ],
  147714. "I3": [ 6108 ],
  147715. "O": [ 6107 ]
  147716. }
  147717. },
  147718. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  147719. "hide_name": 0,
  147720. "type": "SB_LUT4",
  147721. "parameters": {
  147722. "LUT_INIT": "0110100110010110"
  147723. },
  147724. "attributes": {
  147725. "module_not_derived": "00000000000000000000000000000001",
  147726. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147727. },
  147728. "port_directions": {
  147729. "I0": "input",
  147730. "I1": "input",
  147731. "I2": "input",
  147732. "I3": "input",
  147733. "O": "output"
  147734. },
  147735. "connections": {
  147736. "I0": [ "0" ],
  147737. "I1": [ 6058 ],
  147738. "I2": [ "1" ],
  147739. "I3": [ 6104 ],
  147740. "O": [ 6108 ]
  147741. }
  147742. },
  147743. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  147744. "hide_name": 0,
  147745. "type": "SB_CARRY",
  147746. "parameters": {
  147747. },
  147748. "attributes": {
  147749. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147750. },
  147751. "port_directions": {
  147752. "CI": "input",
  147753. "CO": "output",
  147754. "I0": "input",
  147755. "I1": "input"
  147756. },
  147757. "connections": {
  147758. "CI": [ 6109 ],
  147759. "CO": [ 6104 ],
  147760. "I0": [ 6060 ],
  147761. "I1": [ "1" ]
  147762. }
  147763. },
  147764. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  147765. "hide_name": 0,
  147766. "type": "SB_CARRY",
  147767. "parameters": {
  147768. },
  147769. "attributes": {
  147770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147771. },
  147772. "port_directions": {
  147773. "CI": "input",
  147774. "CO": "output",
  147775. "I0": "input",
  147776. "I1": "input"
  147777. },
  147778. "connections": {
  147779. "CI": [ 6110 ],
  147780. "CO": [ 6105 ],
  147781. "I0": [ 6019 ],
  147782. "I1": [ "1" ]
  147783. }
  147784. },
  147785. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7": {
  147786. "hide_name": 0,
  147787. "type": "SB_LUT4",
  147788. "parameters": {
  147789. "LUT_INIT": "1111110000110000"
  147790. },
  147791. "attributes": {
  147792. "module_not_derived": "00000000000000000000000000000001",
  147793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147794. },
  147795. "port_directions": {
  147796. "I0": "input",
  147797. "I1": "input",
  147798. "I2": "input",
  147799. "I3": "input",
  147800. "O": "output"
  147801. },
  147802. "connections": {
  147803. "I0": [ "0" ],
  147804. "I1": [ 6039 ],
  147805. "I2": [ 6111 ],
  147806. "I3": [ 6112 ],
  147807. "O": [ 6059 ]
  147808. }
  147809. },
  147810. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O": {
  147811. "hide_name": 0,
  147812. "type": "SB_LUT4",
  147813. "parameters": {
  147814. "LUT_INIT": "0110100110010110"
  147815. },
  147816. "attributes": {
  147817. "module_not_derived": "00000000000000000000000000000001",
  147818. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147819. },
  147820. "port_directions": {
  147821. "I0": "input",
  147822. "I1": "input",
  147823. "I2": "input",
  147824. "I3": "input",
  147825. "O": "output"
  147826. },
  147827. "connections": {
  147828. "I0": [ "0" ],
  147829. "I1": [ 6019 ],
  147830. "I2": [ "1" ],
  147831. "I3": [ 6110 ],
  147832. "O": [ 6111 ]
  147833. }
  147834. },
  147835. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_1": {
  147836. "hide_name": 0,
  147837. "type": "SB_LUT4",
  147838. "parameters": {
  147839. "LUT_INIT": "1111001111000000"
  147840. },
  147841. "attributes": {
  147842. "module_not_derived": "00000000000000000000000000000001",
  147843. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147844. },
  147845. "port_directions": {
  147846. "I0": "input",
  147847. "I1": "input",
  147848. "I2": "input",
  147849. "I3": "input",
  147850. "O": "output"
  147851. },
  147852. "connections": {
  147853. "I0": [ "0" ],
  147854. "I1": [ 6038 ],
  147855. "I2": [ 6020 ],
  147856. "I3": [ 6113 ],
  147857. "O": [ 6112 ]
  147858. }
  147859. },
  147860. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  147861. "hide_name": 0,
  147862. "type": "SB_LUT4",
  147863. "parameters": {
  147864. "LUT_INIT": "0110100110010110"
  147865. },
  147866. "attributes": {
  147867. "module_not_derived": "00000000000000000000000000000001",
  147868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147869. },
  147870. "port_directions": {
  147871. "I0": "input",
  147872. "I1": "input",
  147873. "I2": "input",
  147874. "I3": "input",
  147875. "O": "output"
  147876. },
  147877. "connections": {
  147878. "I0": [ "0" ],
  147879. "I1": [ 6060 ],
  147880. "I2": [ "1" ],
  147881. "I3": [ 6109 ],
  147882. "O": [ 6113 ]
  147883. }
  147884. },
  147885. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  147886. "hide_name": 0,
  147887. "type": "SB_CARRY",
  147888. "parameters": {
  147889. },
  147890. "attributes": {
  147891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147892. },
  147893. "port_directions": {
  147894. "CI": "input",
  147895. "CO": "output",
  147896. "I0": "input",
  147897. "I1": "input"
  147898. },
  147899. "connections": {
  147900. "CI": [ 6114 ],
  147901. "CO": [ 6109 ],
  147902. "I0": [ 6062 ],
  147903. "I1": [ "1" ]
  147904. }
  147905. },
  147906. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  147907. "hide_name": 0,
  147908. "type": "SB_CARRY",
  147909. "parameters": {
  147910. },
  147911. "attributes": {
  147912. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  147913. },
  147914. "port_directions": {
  147915. "CI": "input",
  147916. "CO": "output",
  147917. "I0": "input",
  147918. "I1": "input"
  147919. },
  147920. "connections": {
  147921. "CI": [ 6115 ],
  147922. "CO": [ 6110 ],
  147923. "I0": [ 6020 ],
  147924. "I1": [ "1" ]
  147925. }
  147926. },
  147927. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8": {
  147928. "hide_name": 0,
  147929. "type": "SB_LUT4",
  147930. "parameters": {
  147931. "LUT_INIT": "1111110000110000"
  147932. },
  147933. "attributes": {
  147934. "module_not_derived": "00000000000000000000000000000001",
  147935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147936. },
  147937. "port_directions": {
  147938. "I0": "input",
  147939. "I1": "input",
  147940. "I2": "input",
  147941. "I3": "input",
  147942. "O": "output"
  147943. },
  147944. "connections": {
  147945. "I0": [ "0" ],
  147946. "I1": [ 6039 ],
  147947. "I2": [ 6116 ],
  147948. "I3": [ 6117 ],
  147949. "O": [ 6061 ]
  147950. }
  147951. },
  147952. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O": {
  147953. "hide_name": 0,
  147954. "type": "SB_LUT4",
  147955. "parameters": {
  147956. "LUT_INIT": "0110100110010110"
  147957. },
  147958. "attributes": {
  147959. "module_not_derived": "00000000000000000000000000000001",
  147960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  147961. },
  147962. "port_directions": {
  147963. "I0": "input",
  147964. "I1": "input",
  147965. "I2": "input",
  147966. "I3": "input",
  147967. "O": "output"
  147968. },
  147969. "connections": {
  147970. "I0": [ "0" ],
  147971. "I1": [ 6020 ],
  147972. "I2": [ "1" ],
  147973. "I3": [ 6115 ],
  147974. "O": [ 6116 ]
  147975. }
  147976. },
  147977. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_1": {
  147978. "hide_name": 0,
  147979. "type": "SB_LUT4",
  147980. "parameters": {
  147981. "LUT_INIT": "1111001111000000"
  147982. },
  147983. "attributes": {
  147984. "module_not_derived": "00000000000000000000000000000001",
  147985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  147986. },
  147987. "port_directions": {
  147988. "I0": "input",
  147989. "I1": "input",
  147990. "I2": "input",
  147991. "I3": "input",
  147992. "O": "output"
  147993. },
  147994. "connections": {
  147995. "I0": [ "0" ],
  147996. "I1": [ 6038 ],
  147997. "I2": [ 6021 ],
  147998. "I3": [ 6118 ],
  147999. "O": [ 6117 ]
  148000. }
  148001. },
  148002. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O": {
  148003. "hide_name": 0,
  148004. "type": "SB_LUT4",
  148005. "parameters": {
  148006. "LUT_INIT": "0110100110010110"
  148007. },
  148008. "attributes": {
  148009. "module_not_derived": "00000000000000000000000000000001",
  148010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148011. },
  148012. "port_directions": {
  148013. "I0": "input",
  148014. "I1": "input",
  148015. "I2": "input",
  148016. "I3": "input",
  148017. "O": "output"
  148018. },
  148019. "connections": {
  148020. "I0": [ "0" ],
  148021. "I1": [ 6062 ],
  148022. "I2": [ "1" ],
  148023. "I3": [ 6114 ],
  148024. "O": [ 6118 ]
  148025. }
  148026. },
  148027. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  148028. "hide_name": 0,
  148029. "type": "SB_CARRY",
  148030. "parameters": {
  148031. },
  148032. "attributes": {
  148033. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148034. },
  148035. "port_directions": {
  148036. "CI": "input",
  148037. "CO": "output",
  148038. "I0": "input",
  148039. "I1": "input"
  148040. },
  148041. "connections": {
  148042. "CI": [ 6119 ],
  148043. "CO": [ 6114 ],
  148044. "I0": [ 6064 ],
  148045. "I1": [ "1" ]
  148046. }
  148047. },
  148048. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  148049. "hide_name": 0,
  148050. "type": "SB_CARRY",
  148051. "parameters": {
  148052. },
  148053. "attributes": {
  148054. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148055. },
  148056. "port_directions": {
  148057. "CI": "input",
  148058. "CO": "output",
  148059. "I0": "input",
  148060. "I1": "input"
  148061. },
  148062. "connections": {
  148063. "CI": [ 6120 ],
  148064. "CO": [ 6115 ],
  148065. "I0": [ 6021 ],
  148066. "I1": [ "1" ]
  148067. }
  148068. },
  148069. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9": {
  148070. "hide_name": 0,
  148071. "type": "SB_LUT4",
  148072. "parameters": {
  148073. "LUT_INIT": "1111110000001100"
  148074. },
  148075. "attributes": {
  148076. "module_not_derived": "00000000000000000000000000000001",
  148077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  148078. },
  148079. "port_directions": {
  148080. "I0": "input",
  148081. "I1": "input",
  148082. "I2": "input",
  148083. "I3": "input",
  148084. "O": "output"
  148085. },
  148086. "connections": {
  148087. "I0": [ "0" ],
  148088. "I1": [ 6121 ],
  148089. "I2": [ 6039 ],
  148090. "I3": [ 6122 ],
  148091. "O": [ 6063 ]
  148092. }
  148093. },
  148094. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O": {
  148095. "hide_name": 0,
  148096. "type": "SB_LUT4",
  148097. "parameters": {
  148098. "LUT_INIT": "0110100110010110"
  148099. },
  148100. "attributes": {
  148101. "module_not_derived": "00000000000000000000000000000001",
  148102. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148103. },
  148104. "port_directions": {
  148105. "I0": "input",
  148106. "I1": "input",
  148107. "I2": "input",
  148108. "I3": "input",
  148109. "O": "output"
  148110. },
  148111. "connections": {
  148112. "I0": [ "0" ],
  148113. "I1": [ 6021 ],
  148114. "I2": [ "1" ],
  148115. "I3": [ 6120 ],
  148116. "O": [ 6121 ]
  148117. }
  148118. },
  148119. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_1": {
  148120. "hide_name": 0,
  148121. "type": "SB_LUT4",
  148122. "parameters": {
  148123. "LUT_INIT": "1111001111000000"
  148124. },
  148125. "attributes": {
  148126. "module_not_derived": "00000000000000000000000000000001",
  148127. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  148128. },
  148129. "port_directions": {
  148130. "I0": "input",
  148131. "I1": "input",
  148132. "I2": "input",
  148133. "I3": "input",
  148134. "O": "output"
  148135. },
  148136. "connections": {
  148137. "I0": [ "0" ],
  148138. "I1": [ 6038 ],
  148139. "I2": [ 6022 ],
  148140. "I3": [ 6123 ],
  148141. "O": [ 6122 ]
  148142. }
  148143. },
  148144. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_1_I3_SB_LUT4_O": {
  148145. "hide_name": 0,
  148146. "type": "SB_LUT4",
  148147. "parameters": {
  148148. "LUT_INIT": "0110100110010110"
  148149. },
  148150. "attributes": {
  148151. "module_not_derived": "00000000000000000000000000000001",
  148152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148153. },
  148154. "port_directions": {
  148155. "I0": "input",
  148156. "I1": "input",
  148157. "I2": "input",
  148158. "I3": "input",
  148159. "O": "output"
  148160. },
  148161. "connections": {
  148162. "I0": [ "0" ],
  148163. "I1": [ 6064 ],
  148164. "I2": [ "1" ],
  148165. "I3": [ 6119 ],
  148166. "O": [ 6123 ]
  148167. }
  148168. },
  148169. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  148170. "hide_name": 0,
  148171. "type": "SB_CARRY",
  148172. "parameters": {
  148173. },
  148174. "attributes": {
  148175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148176. },
  148177. "port_directions": {
  148178. "CI": "input",
  148179. "CO": "output",
  148180. "I0": "input",
  148181. "I1": "input"
  148182. },
  148183. "connections": {
  148184. "CI": [ 6048 ],
  148185. "CO": [ 6119 ],
  148186. "I0": [ 6046 ],
  148187. "I1": [ "1" ]
  148188. }
  148189. },
  148190. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_I3_SB_CARRY_CO": {
  148191. "hide_name": 0,
  148192. "type": "SB_CARRY",
  148193. "parameters": {
  148194. },
  148195. "attributes": {
  148196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148197. },
  148198. "port_directions": {
  148199. "CI": "input",
  148200. "CO": "output",
  148201. "I0": "input",
  148202. "I1": "input"
  148203. },
  148204. "connections": {
  148205. "CI": [ 6013 ],
  148206. "CO": [ 6120 ],
  148207. "I0": [ 6022 ],
  148208. "I1": [ "1" ]
  148209. }
  148210. },
  148211. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O": {
  148212. "hide_name": 0,
  148213. "type": "SB_LUT4",
  148214. "parameters": {
  148215. "LUT_INIT": "1101000010000000"
  148216. },
  148217. "attributes": {
  148218. "module_not_derived": "00000000000000000000000000000001",
  148219. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148220. },
  148221. "port_directions": {
  148222. "I0": "input",
  148223. "I1": "input",
  148224. "I2": "input",
  148225. "I3": "input",
  148226. "O": "output"
  148227. },
  148228. "connections": {
  148229. "I0": [ 6038 ],
  148230. "I1": [ 6011 ],
  148231. "I2": [ 6039 ],
  148232. "I3": [ 6075 ],
  148233. "O": [ 6080 ]
  148234. }
  148235. },
  148236. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO": {
  148237. "hide_name": 0,
  148238. "type": "SB_CARRY",
  148239. "parameters": {
  148240. },
  148241. "attributes": {
  148242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148243. },
  148244. "port_directions": {
  148245. "CI": "input",
  148246. "CO": "output",
  148247. "I0": "input",
  148248. "I1": "input"
  148249. },
  148250. "connections": {
  148251. "CI": [ 6124 ],
  148252. "CO": [ 6074 ],
  148253. "I0": [ 6044 ],
  148254. "I1": [ "1" ]
  148255. }
  148256. },
  148257. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  148258. "hide_name": 0,
  148259. "type": "SB_CARRY",
  148260. "parameters": {
  148261. },
  148262. "attributes": {
  148263. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148264. },
  148265. "port_directions": {
  148266. "CI": "input",
  148267. "CO": "output",
  148268. "I0": "input",
  148269. "I1": "input"
  148270. },
  148271. "connections": {
  148272. "CI": [ 6125 ],
  148273. "CO": [ 6124 ],
  148274. "I0": [ 6050 ],
  148275. "I1": [ "1" ]
  148276. }
  148277. },
  148278. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  148279. "hide_name": 0,
  148280. "type": "SB_CARRY",
  148281. "parameters": {
  148282. },
  148283. "attributes": {
  148284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148285. },
  148286. "port_directions": {
  148287. "CI": "input",
  148288. "CO": "output",
  148289. "I0": "input",
  148290. "I1": "input"
  148291. },
  148292. "connections": {
  148293. "CI": [ 6126 ],
  148294. "CO": [ 6125 ],
  148295. "I0": [ 6052 ],
  148296. "I1": [ "1" ]
  148297. }
  148298. },
  148299. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  148300. "hide_name": 0,
  148301. "type": "SB_CARRY",
  148302. "parameters": {
  148303. },
  148304. "attributes": {
  148305. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148306. },
  148307. "port_directions": {
  148308. "CI": "input",
  148309. "CO": "output",
  148310. "I0": "input",
  148311. "I1": "input"
  148312. },
  148313. "connections": {
  148314. "CI": [ 6098 ],
  148315. "CO": [ 6126 ],
  148316. "I0": [ 6054 ],
  148317. "I1": [ "1" ]
  148318. }
  148319. },
  148320. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  148321. "hide_name": 0,
  148322. "type": "SB_CARRY",
  148323. "parameters": {
  148324. },
  148325. "attributes": {
  148326. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148327. },
  148328. "port_directions": {
  148329. "CI": "input",
  148330. "CO": "output",
  148331. "I0": "input",
  148332. "I1": "input"
  148333. },
  148334. "connections": {
  148335. "CI": [ 6103 ],
  148336. "CO": [ 6098 ],
  148337. "I0": [ 6056 ],
  148338. "I1": [ "1" ]
  148339. }
  148340. },
  148341. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_LUT4_I3": {
  148342. "hide_name": 0,
  148343. "type": "SB_LUT4",
  148344. "parameters": {
  148345. "LUT_INIT": "0110100110010110"
  148346. },
  148347. "attributes": {
  148348. "module_not_derived": "00000000000000000000000000000001",
  148349. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148350. },
  148351. "port_directions": {
  148352. "I0": "input",
  148353. "I1": "input",
  148354. "I2": "input",
  148355. "I3": "input",
  148356. "O": "output"
  148357. },
  148358. "connections": {
  148359. "I0": [ "0" ],
  148360. "I1": [ 6052 ],
  148361. "I2": [ "1" ],
  148362. "I3": [ 6126 ],
  148363. "O": [ 6093 ]
  148364. }
  148365. },
  148366. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_LUT4_I3": {
  148367. "hide_name": 0,
  148368. "type": "SB_LUT4",
  148369. "parameters": {
  148370. "LUT_INIT": "0110100110010110"
  148371. },
  148372. "attributes": {
  148373. "module_not_derived": "00000000000000000000000000000001",
  148374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148375. },
  148376. "port_directions": {
  148377. "I0": "input",
  148378. "I1": "input",
  148379. "I2": "input",
  148380. "I3": "input",
  148381. "O": "output"
  148382. },
  148383. "connections": {
  148384. "I0": [ "0" ],
  148385. "I1": [ 6050 ],
  148386. "I2": [ "1" ],
  148387. "I3": [ 6125 ],
  148388. "O": [ 6089 ]
  148389. }
  148390. },
  148391. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3": {
  148392. "hide_name": 0,
  148393. "type": "SB_LUT4",
  148394. "parameters": {
  148395. "LUT_INIT": "0110100110010110"
  148396. },
  148397. "attributes": {
  148398. "module_not_derived": "00000000000000000000000000000001",
  148399. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148400. },
  148401. "port_directions": {
  148402. "I0": "input",
  148403. "I1": "input",
  148404. "I2": "input",
  148405. "I3": "input",
  148406. "O": "output"
  148407. },
  148408. "connections": {
  148409. "I0": [ "0" ],
  148410. "I1": [ 6044 ],
  148411. "I2": [ "1" ],
  148412. "I3": [ 6124 ],
  148413. "O": [ 6127 ]
  148414. }
  148415. },
  148416. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3": {
  148417. "hide_name": 0,
  148418. "type": "SB_LUT4",
  148419. "parameters": {
  148420. "LUT_INIT": "1111001111000000"
  148421. },
  148422. "attributes": {
  148423. "module_not_derived": "00000000000000000000000000000001",
  148424. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  148425. },
  148426. "port_directions": {
  148427. "I0": "input",
  148428. "I1": "input",
  148429. "I2": "input",
  148430. "I3": "input",
  148431. "O": "output"
  148432. },
  148433. "connections": {
  148434. "I0": [ "0" ],
  148435. "I1": [ 6038 ],
  148436. "I2": [ 6012 ],
  148437. "I3": [ 6127 ],
  148438. "O": [ 6086 ]
  148439. }
  148440. },
  148441. "uart_I.uart_rx_I.genblk1.gf_I.state_SB_DFFSS_Q": {
  148442. "hide_name": 0,
  148443. "type": "SB_DFFSS",
  148444. "parameters": {
  148445. },
  148446. "attributes": {
  148447. "module_not_derived": "00000000000000000000000000000001",
  148448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:80.2-90.6|/usr/bin/../share/yosys/ice40/ff_map.v:20.59-20.105"
  148449. },
  148450. "port_directions": {
  148451. "C": "input",
  148452. "D": "input",
  148453. "Q": "output",
  148454. "S": "input"
  148455. },
  148456. "connections": {
  148457. "C": [ 42 ],
  148458. "D": [ 6128 ],
  148459. "Q": [ 6072 ],
  148460. "S": [ 127 ]
  148461. }
  148462. },
  148463. "uart_I.uart_rx_I.genblk1.gf_I.state_SB_DFFSS_Q_D_SB_LUT4_O": {
  148464. "hide_name": 0,
  148465. "type": "SB_LUT4",
  148466. "parameters": {
  148467. "LUT_INIT": "1111110011000000"
  148468. },
  148469. "attributes": {
  148470. "module_not_derived": "00000000000000000000000000000001",
  148471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  148472. },
  148473. "port_directions": {
  148474. "I0": "input",
  148475. "I1": "input",
  148476. "I2": "input",
  148477. "I3": "input",
  148478. "O": "output"
  148479. },
  148480. "connections": {
  148481. "I0": [ "0" ],
  148482. "I1": [ 6072 ],
  148483. "I2": [ 6066 ],
  148484. "I3": [ 6068 ],
  148485. "O": [ 6128 ]
  148486. }
  148487. },
  148488. "uart_I.uart_rx_I.genblk1.gf_I.sync_SB_DFF_Q": {
  148489. "hide_name": 0,
  148490. "type": "SB_DFF",
  148491. "parameters": {
  148492. },
  148493. "attributes": {
  148494. "module_not_derived": "00000000000000000000000000000001",
  148495. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:53.3-54.28|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  148496. },
  148497. "port_directions": {
  148498. "C": "input",
  148499. "D": "input",
  148500. "Q": "output"
  148501. },
  148502. "connections": {
  148503. "C": [ 42 ],
  148504. "D": [ 6129 ],
  148505. "Q": [ 6069 ]
  148506. }
  148507. },
  148508. "uart_I.uart_rx_I.genblk1.gf_I.sync_SB_DFF_Q_1": {
  148509. "hide_name": 0,
  148510. "type": "SB_DFF",
  148511. "parameters": {
  148512. },
  148513. "attributes": {
  148514. "module_not_derived": "00000000000000000000000000000001",
  148515. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:53.3-54.28|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  148516. },
  148517. "port_directions": {
  148518. "C": "input",
  148519. "D": "input",
  148520. "Q": "output"
  148521. },
  148522. "connections": {
  148523. "C": [ 42 ],
  148524. "D": [ 25 ],
  148525. "Q": [ 6129 ]
  148526. }
  148527. },
  148528. "uart_I.uart_rx_I.shift_SB_DFFE_Q": {
  148529. "hide_name": 0,
  148530. "type": "SB_DFFE",
  148531. "parameters": {
  148532. },
  148533. "attributes": {
  148534. "module_not_derived": "00000000000000000000000000000001",
  148535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148536. },
  148537. "port_directions": {
  148538. "C": "input",
  148539. "D": "input",
  148540. "E": "input",
  148541. "Q": "output"
  148542. },
  148543. "connections": {
  148544. "C": [ 42 ],
  148545. "D": [ 6072 ],
  148546. "E": [ 6038 ],
  148547. "Q": [ 6130 ]
  148548. }
  148549. },
  148550. "uart_I.uart_rx_I.shift_SB_DFFE_Q_1": {
  148551. "hide_name": 0,
  148552. "type": "SB_DFFE",
  148553. "parameters": {
  148554. },
  148555. "attributes": {
  148556. "module_not_derived": "00000000000000000000000000000001",
  148557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148558. },
  148559. "port_directions": {
  148560. "C": "input",
  148561. "D": "input",
  148562. "E": "input",
  148563. "Q": "output"
  148564. },
  148565. "connections": {
  148566. "C": [ 42 ],
  148567. "D": [ 6130 ],
  148568. "E": [ 6038 ],
  148569. "Q": [ 6131 ]
  148570. }
  148571. },
  148572. "uart_I.uart_rx_I.shift_SB_DFFE_Q_2": {
  148573. "hide_name": 0,
  148574. "type": "SB_DFFE",
  148575. "parameters": {
  148576. },
  148577. "attributes": {
  148578. "module_not_derived": "00000000000000000000000000000001",
  148579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148580. },
  148581. "port_directions": {
  148582. "C": "input",
  148583. "D": "input",
  148584. "E": "input",
  148585. "Q": "output"
  148586. },
  148587. "connections": {
  148588. "C": [ 42 ],
  148589. "D": [ 6131 ],
  148590. "E": [ 6038 ],
  148591. "Q": [ 6132 ]
  148592. }
  148593. },
  148594. "uart_I.uart_rx_I.shift_SB_DFFE_Q_3": {
  148595. "hide_name": 0,
  148596. "type": "SB_DFFE",
  148597. "parameters": {
  148598. },
  148599. "attributes": {
  148600. "module_not_derived": "00000000000000000000000000000001",
  148601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148602. },
  148603. "port_directions": {
  148604. "C": "input",
  148605. "D": "input",
  148606. "E": "input",
  148607. "Q": "output"
  148608. },
  148609. "connections": {
  148610. "C": [ 42 ],
  148611. "D": [ 6132 ],
  148612. "E": [ 6038 ],
  148613. "Q": [ 6133 ]
  148614. }
  148615. },
  148616. "uart_I.uart_rx_I.shift_SB_DFFE_Q_4": {
  148617. "hide_name": 0,
  148618. "type": "SB_DFFE",
  148619. "parameters": {
  148620. },
  148621. "attributes": {
  148622. "module_not_derived": "00000000000000000000000000000001",
  148623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148624. },
  148625. "port_directions": {
  148626. "C": "input",
  148627. "D": "input",
  148628. "E": "input",
  148629. "Q": "output"
  148630. },
  148631. "connections": {
  148632. "C": [ 42 ],
  148633. "D": [ 6133 ],
  148634. "E": [ 6038 ],
  148635. "Q": [ 6134 ]
  148636. }
  148637. },
  148638. "uart_I.uart_rx_I.shift_SB_DFFE_Q_5": {
  148639. "hide_name": 0,
  148640. "type": "SB_DFFE",
  148641. "parameters": {
  148642. },
  148643. "attributes": {
  148644. "module_not_derived": "00000000000000000000000000000001",
  148645. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148646. },
  148647. "port_directions": {
  148648. "C": "input",
  148649. "D": "input",
  148650. "E": "input",
  148651. "Q": "output"
  148652. },
  148653. "connections": {
  148654. "C": [ 42 ],
  148655. "D": [ 6134 ],
  148656. "E": [ 6038 ],
  148657. "Q": [ 6135 ]
  148658. }
  148659. },
  148660. "uart_I.uart_rx_I.shift_SB_DFFE_Q_6": {
  148661. "hide_name": 0,
  148662. "type": "SB_DFFE",
  148663. "parameters": {
  148664. },
  148665. "attributes": {
  148666. "module_not_derived": "00000000000000000000000000000001",
  148667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148668. },
  148669. "port_directions": {
  148670. "C": "input",
  148671. "D": "input",
  148672. "E": "input",
  148673. "Q": "output"
  148674. },
  148675. "connections": {
  148676. "C": [ 42 ],
  148677. "D": [ 6135 ],
  148678. "E": [ 6038 ],
  148679. "Q": [ 6136 ]
  148680. }
  148681. },
  148682. "uart_I.uart_rx_I.shift_SB_DFFE_Q_7": {
  148683. "hide_name": 0,
  148684. "type": "SB_DFFE",
  148685. "parameters": {
  148686. },
  148687. "attributes": {
  148688. "module_not_derived": "00000000000000000000000000000001",
  148689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148690. },
  148691. "port_directions": {
  148692. "C": "input",
  148693. "D": "input",
  148694. "E": "input",
  148695. "Q": "output"
  148696. },
  148697. "connections": {
  148698. "C": [ 42 ],
  148699. "D": [ 6136 ],
  148700. "E": [ 6038 ],
  148701. "Q": [ 6137 ]
  148702. }
  148703. },
  148704. "uart_I.uart_rx_I.shift_SB_DFFE_Q_8": {
  148705. "hide_name": 0,
  148706. "type": "SB_DFFE",
  148707. "parameters": {
  148708. },
  148709. "attributes": {
  148710. "module_not_derived": "00000000000000000000000000000001",
  148711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:95.2-97.36|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  148712. },
  148713. "port_directions": {
  148714. "C": "input",
  148715. "D": "input",
  148716. "E": "input",
  148717. "Q": "output"
  148718. },
  148719. "connections": {
  148720. "C": [ 42 ],
  148721. "D": [ 6137 ],
  148722. "E": [ 6038 ],
  148723. "Q": [ 6138 ]
  148724. }
  148725. },
  148726. "uart_I.uart_rx_I.stb_SB_DFF_Q": {
  148727. "hide_name": 0,
  148728. "type": "SB_DFF",
  148729. "parameters": {
  148730. },
  148731. "attributes": {
  148732. "module_not_derived": "00000000000000000000000000000001",
  148733. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:102.2-103.35|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  148734. },
  148735. "port_directions": {
  148736. "C": "input",
  148737. "D": "input",
  148738. "Q": "output"
  148739. },
  148740. "connections": {
  148741. "C": [ 42 ],
  148742. "D": [ 6139 ],
  148743. "Q": [ 6140 ]
  148744. }
  148745. },
  148746. "uart_I.uart_rx_I.stb_SB_DFF_Q_D_SB_LUT4_O": {
  148747. "hide_name": 0,
  148748. "type": "SB_LUT4",
  148749. "parameters": {
  148750. "LUT_INIT": "1100000000000000"
  148751. },
  148752. "attributes": {
  148753. "module_not_derived": "00000000000000000000000000000001",
  148754. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  148755. },
  148756. "port_directions": {
  148757. "I0": "input",
  148758. "I1": "input",
  148759. "I2": "input",
  148760. "I3": "input",
  148761. "O": "output"
  148762. },
  148763. "connections": {
  148764. "I0": [ "0" ],
  148765. "I1": [ 6038 ],
  148766. "I2": [ 6072 ],
  148767. "I3": [ 6025 ],
  148768. "O": [ 6139 ]
  148769. }
  148770. },
  148771. "uart_I.uart_rx_I.stb_SB_LUT4_I0": {
  148772. "hide_name": 0,
  148773. "type": "SB_LUT4",
  148774. "parameters": {
  148775. "LUT_INIT": "0000000000100000"
  148776. },
  148777. "attributes": {
  148778. "module_not_derived": "00000000000000000000000000000001",
  148779. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148780. },
  148781. "port_directions": {
  148782. "I0": "input",
  148783. "I1": "input",
  148784. "I2": "input",
  148785. "I3": "input",
  148786. "O": "output"
  148787. },
  148788. "connections": {
  148789. "I0": [ 6140 ],
  148790. "I1": [ 6141 ],
  148791. "I2": [ 6142 ],
  148792. "I3": [ 6143 ],
  148793. "O": [ 6144 ]
  148794. }
  148795. },
  148796. "uart_I.uart_rx_I.stb_SB_LUT4_I0_I2_SB_DFFS_Q": {
  148797. "hide_name": 0,
  148798. "type": "SB_DFFS",
  148799. "parameters": {
  148800. },
  148801. "attributes": {
  148802. "module_not_derived": "00000000000000000000000000000001",
  148803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  148804. },
  148805. "port_directions": {
  148806. "C": "input",
  148807. "D": "input",
  148808. "Q": "output",
  148809. "S": "input"
  148810. },
  148811. "connections": {
  148812. "C": [ 42 ],
  148813. "D": [ 6145 ],
  148814. "Q": [ 6142 ],
  148815. "S": [ 127 ]
  148816. }
  148817. },
  148818. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O": {
  148819. "hide_name": 0,
  148820. "type": "SB_LUT4",
  148821. "parameters": {
  148822. "LUT_INIT": "1000000000000000"
  148823. },
  148824. "attributes": {
  148825. "module_not_derived": "00000000000000000000000000000001",
  148826. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  148827. },
  148828. "port_directions": {
  148829. "I0": "input",
  148830. "I1": "input",
  148831. "I2": "input",
  148832. "I3": "input",
  148833. "O": "output"
  148834. },
  148835. "connections": {
  148836. "I0": [ 6146 ],
  148837. "I1": [ 6147 ],
  148838. "I2": [ 6148 ],
  148839. "I3": [ 6149 ],
  148840. "O": [ 6150 ]
  148841. }
  148842. },
  148843. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1": {
  148844. "hide_name": 0,
  148845. "type": "SB_LUT4",
  148846. "parameters": {
  148847. "LUT_INIT": "1100000000000000"
  148848. },
  148849. "attributes": {
  148850. "module_not_derived": "00000000000000000000000000000001",
  148851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  148852. },
  148853. "port_directions": {
  148854. "I0": "input",
  148855. "I1": "input",
  148856. "I2": "input",
  148857. "I3": "input",
  148858. "O": "output"
  148859. },
  148860. "connections": {
  148861. "I0": [ "0" ],
  148862. "I1": [ 6151 ],
  148863. "I2": [ 6152 ],
  148864. "I3": [ 6153 ],
  148865. "O": [ 6154 ]
  148866. }
  148867. },
  148868. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I1_SB_CARRY_CO": {
  148869. "hide_name": 0,
  148870. "type": "SB_CARRY",
  148871. "parameters": {
  148872. },
  148873. "attributes": {
  148874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148875. },
  148876. "port_directions": {
  148877. "CI": "input",
  148878. "CO": "output",
  148879. "I0": "input",
  148880. "I1": "input"
  148881. },
  148882. "connections": {
  148883. "CI": [ 6155 ],
  148884. "CO": [ 6156 ],
  148885. "I0": [ 6152 ],
  148886. "I1": [ 6157 ]
  148887. }
  148888. },
  148889. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I1_SB_DFFS_Q": {
  148890. "hide_name": 0,
  148891. "type": "SB_DFFS",
  148892. "parameters": {
  148893. },
  148894. "attributes": {
  148895. "module_not_derived": "00000000000000000000000000000001",
  148896. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  148897. },
  148898. "port_directions": {
  148899. "C": "input",
  148900. "D": "input",
  148901. "Q": "output",
  148902. "S": "input"
  148903. },
  148904. "connections": {
  148905. "C": [ 42 ],
  148906. "D": [ 6158 ],
  148907. "Q": [ 6151 ],
  148908. "S": [ 127 ]
  148909. }
  148910. },
  148911. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I2_SB_CARRY_CO": {
  148912. "hide_name": 0,
  148913. "type": "SB_CARRY",
  148914. "parameters": {
  148915. },
  148916. "attributes": {
  148917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148918. },
  148919. "port_directions": {
  148920. "CI": "input",
  148921. "CO": "output",
  148922. "I0": "input",
  148923. "I1": "input"
  148924. },
  148925. "connections": {
  148926. "CI": [ 6159 ],
  148927. "CO": [ 6155 ],
  148928. "I0": [ 6153 ],
  148929. "I1": [ 6157 ]
  148930. }
  148931. },
  148932. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I2_SB_DFFS_Q": {
  148933. "hide_name": 0,
  148934. "type": "SB_DFFS",
  148935. "parameters": {
  148936. },
  148937. "attributes": {
  148938. "module_not_derived": "00000000000000000000000000000001",
  148939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  148940. },
  148941. "port_directions": {
  148942. "C": "input",
  148943. "D": "input",
  148944. "Q": "output",
  148945. "S": "input"
  148946. },
  148947. "connections": {
  148948. "C": [ 42 ],
  148949. "D": [ 6160 ],
  148950. "Q": [ 6152 ],
  148951. "S": [ 127 ]
  148952. }
  148953. },
  148954. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  148955. "hide_name": 0,
  148956. "type": "SB_CARRY",
  148957. "parameters": {
  148958. },
  148959. "attributes": {
  148960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  148961. },
  148962. "port_directions": {
  148963. "CI": "input",
  148964. "CO": "output",
  148965. "I0": "input",
  148966. "I1": "input"
  148967. },
  148968. "connections": {
  148969. "CI": [ 6161 ],
  148970. "CO": [ 6159 ],
  148971. "I0": [ 6146 ],
  148972. "I1": [ 6157 ]
  148973. }
  148974. },
  148975. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_DFFS_Q": {
  148976. "hide_name": 0,
  148977. "type": "SB_DFFS",
  148978. "parameters": {
  148979. },
  148980. "attributes": {
  148981. "module_not_derived": "00000000000000000000000000000001",
  148982. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  148983. },
  148984. "port_directions": {
  148985. "C": "input",
  148986. "D": "input",
  148987. "Q": "output",
  148988. "S": "input"
  148989. },
  148990. "connections": {
  148991. "C": [ 42 ],
  148992. "D": [ 6162 ],
  148993. "Q": [ 6153 ],
  148994. "S": [ 127 ]
  148995. }
  148996. },
  148997. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I0_SB_CARRY_CO": {
  148998. "hide_name": 0,
  148999. "type": "SB_CARRY",
  149000. "parameters": {
  149001. },
  149002. "attributes": {
  149003. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149004. },
  149005. "port_directions": {
  149006. "CI": "input",
  149007. "CO": "output",
  149008. "I0": "input",
  149009. "I1": "input"
  149010. },
  149011. "connections": {
  149012. "CI": [ 6163 ],
  149013. "CO": [ 6161 ],
  149014. "I0": [ 6147 ],
  149015. "I1": [ 6157 ]
  149016. }
  149017. },
  149018. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I0_SB_DFFS_Q": {
  149019. "hide_name": 0,
  149020. "type": "SB_DFFS",
  149021. "parameters": {
  149022. },
  149023. "attributes": {
  149024. "module_not_derived": "00000000000000000000000000000001",
  149025. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  149026. },
  149027. "port_directions": {
  149028. "C": "input",
  149029. "D": "input",
  149030. "Q": "output",
  149031. "S": "input"
  149032. },
  149033. "connections": {
  149034. "C": [ 42 ],
  149035. "D": [ 6164 ],
  149036. "Q": [ 6146 ],
  149037. "S": [ 127 ]
  149038. }
  149039. },
  149040. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_CARRY_CO": {
  149041. "hide_name": 0,
  149042. "type": "SB_CARRY",
  149043. "parameters": {
  149044. },
  149045. "attributes": {
  149046. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149047. },
  149048. "port_directions": {
  149049. "CI": "input",
  149050. "CO": "output",
  149051. "I0": "input",
  149052. "I1": "input"
  149053. },
  149054. "connections": {
  149055. "CI": [ 6165 ],
  149056. "CO": [ 6163 ],
  149057. "I0": [ 6148 ],
  149058. "I1": [ 6157 ]
  149059. }
  149060. },
  149061. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I1_SB_DFFS_Q": {
  149062. "hide_name": 0,
  149063. "type": "SB_DFFS",
  149064. "parameters": {
  149065. },
  149066. "attributes": {
  149067. "module_not_derived": "00000000000000000000000000000001",
  149068. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  149069. },
  149070. "port_directions": {
  149071. "C": "input",
  149072. "D": "input",
  149073. "Q": "output",
  149074. "S": "input"
  149075. },
  149076. "connections": {
  149077. "C": [ 42 ],
  149078. "D": [ 6166 ],
  149079. "Q": [ 6147 ],
  149080. "S": [ 127 ]
  149081. }
  149082. },
  149083. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I2_SB_CARRY_CO": {
  149084. "hide_name": 0,
  149085. "type": "SB_CARRY",
  149086. "parameters": {
  149087. },
  149088. "attributes": {
  149089. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149090. },
  149091. "port_directions": {
  149092. "CI": "input",
  149093. "CO": "output",
  149094. "I0": "input",
  149095. "I1": "input"
  149096. },
  149097. "connections": {
  149098. "CI": [ 6167 ],
  149099. "CO": [ 6165 ],
  149100. "I0": [ 6149 ],
  149101. "I1": [ 6157 ]
  149102. }
  149103. },
  149104. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I2_SB_DFFS_Q": {
  149105. "hide_name": 0,
  149106. "type": "SB_DFFS",
  149107. "parameters": {
  149108. },
  149109. "attributes": {
  149110. "module_not_derived": "00000000000000000000000000000001",
  149111. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  149112. },
  149113. "port_directions": {
  149114. "C": "input",
  149115. "D": "input",
  149116. "Q": "output",
  149117. "S": "input"
  149118. },
  149119. "connections": {
  149120. "C": [ 42 ],
  149121. "D": [ 6168 ],
  149122. "Q": [ 6148 ],
  149123. "S": [ 127 ]
  149124. }
  149125. },
  149126. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_DFFS_Q": {
  149127. "hide_name": 0,
  149128. "type": "SB_DFFS",
  149129. "parameters": {
  149130. },
  149131. "attributes": {
  149132. "module_not_derived": "00000000000000000000000000000001",
  149133. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  149134. },
  149135. "port_directions": {
  149136. "C": "input",
  149137. "D": "input",
  149138. "Q": "output",
  149139. "S": "input"
  149140. },
  149141. "connections": {
  149142. "C": [ 42 ],
  149143. "D": [ 6169 ],
  149144. "Q": [ 6149 ],
  149145. "S": [ 127 ]
  149146. }
  149147. },
  149148. "uart_I.uart_rx_I.stb_SB_LUT4_I1": {
  149149. "hide_name": 0,
  149150. "type": "SB_LUT4",
  149151. "parameters": {
  149152. "LUT_INIT": "1111111111000000"
  149153. },
  149154. "attributes": {
  149155. "module_not_derived": "00000000000000000000000000000001",
  149156. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  149157. },
  149158. "port_directions": {
  149159. "I0": "input",
  149160. "I1": "input",
  149161. "I2": "input",
  149162. "I3": "input",
  149163. "O": "output"
  149164. },
  149165. "connections": {
  149166. "I0": [ "0" ],
  149167. "I1": [ 6140 ],
  149168. "I2": [ 6170 ],
  149169. "I3": [ 6171 ],
  149170. "O": [ 6172 ]
  149171. }
  149172. },
  149173. "uart_I.uart_rx_fifo_I.lvl_dec_SB_LUT4_O": {
  149174. "hide_name": 0,
  149175. "type": "SB_LUT4",
  149176. "parameters": {
  149177. "LUT_INIT": "0000111100000000"
  149178. },
  149179. "attributes": {
  149180. "module_not_derived": "00000000000000000000000000000001",
  149181. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  149182. },
  149183. "port_directions": {
  149184. "I0": "input",
  149185. "I1": "input",
  149186. "I2": "input",
  149187. "I3": "input",
  149188. "O": "output"
  149189. },
  149190. "connections": {
  149191. "I0": [ "0" ],
  149192. "I1": [ "0" ],
  149193. "I2": [ 6173 ],
  149194. "I3": [ 6174 ],
  149195. "O": [ 6157 ]
  149196. }
  149197. },
  149198. "uart_I.uart_rx_fifo_I.lvl_mov_SB_CARRY_I1": {
  149199. "hide_name": 0,
  149200. "type": "SB_CARRY",
  149201. "parameters": {
  149202. },
  149203. "attributes": {
  149204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149205. },
  149206. "port_directions": {
  149207. "CI": "input",
  149208. "CO": "output",
  149209. "I0": "input",
  149210. "I1": "input"
  149211. },
  149212. "connections": {
  149213. "CI": [ "0" ],
  149214. "CO": [ 6175 ],
  149215. "I0": [ 6142 ],
  149216. "I1": [ 6176 ]
  149217. }
  149218. },
  149219. "uart_I.uart_rx_fifo_I.lvl_mov_SB_CARRY_I1_CO_SB_CARRY_CI": {
  149220. "hide_name": 0,
  149221. "type": "SB_CARRY",
  149222. "parameters": {
  149223. },
  149224. "attributes": {
  149225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149226. },
  149227. "port_directions": {
  149228. "CI": "input",
  149229. "CO": "output",
  149230. "I0": "input",
  149231. "I1": "input"
  149232. },
  149233. "connections": {
  149234. "CI": [ 6175 ],
  149235. "CO": [ 6167 ],
  149236. "I0": [ 6141 ],
  149237. "I1": [ 6157 ]
  149238. }
  149239. },
  149240. "uart_I.uart_rx_fifo_I.lvl_mov_SB_CARRY_I1_CO_SB_DFFS_Q": {
  149241. "hide_name": 0,
  149242. "type": "SB_DFFS",
  149243. "parameters": {
  149244. },
  149245. "attributes": {
  149246. "module_not_derived": "00000000000000000000000000000001",
  149247. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  149248. },
  149249. "port_directions": {
  149250. "C": "input",
  149251. "D": "input",
  149252. "Q": "output",
  149253. "S": "input"
  149254. },
  149255. "connections": {
  149256. "C": [ 42 ],
  149257. "D": [ 6177 ],
  149258. "Q": [ 6141 ],
  149259. "S": [ 127 ]
  149260. }
  149261. },
  149262. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2": {
  149263. "hide_name": 0,
  149264. "type": "SB_LUT4",
  149265. "parameters": {
  149266. "LUT_INIT": "0110100110010110"
  149267. },
  149268. "attributes": {
  149269. "module_not_derived": "00000000000000000000000000000001",
  149270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149271. },
  149272. "port_directions": {
  149273. "I0": "input",
  149274. "I1": "input",
  149275. "I2": "input",
  149276. "I3": "input",
  149277. "O": "output"
  149278. },
  149279. "connections": {
  149280. "I0": [ "0" ],
  149281. "I1": [ 6142 ],
  149282. "I2": [ 6176 ],
  149283. "I3": [ "0" ],
  149284. "O": [ 6145 ]
  149285. }
  149286. },
  149287. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O": {
  149288. "hide_name": 0,
  149289. "type": "SB_LUT4",
  149290. "parameters": {
  149291. "LUT_INIT": "0110100110010110"
  149292. },
  149293. "attributes": {
  149294. "module_not_derived": "00000000000000000000000000000001",
  149295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149296. },
  149297. "port_directions": {
  149298. "I0": "input",
  149299. "I1": "input",
  149300. "I2": "input",
  149301. "I3": "input",
  149302. "O": "output"
  149303. },
  149304. "connections": {
  149305. "I0": [ "0" ],
  149306. "I1": [ 6151 ],
  149307. "I2": [ 6157 ],
  149308. "I3": [ 6156 ],
  149309. "O": [ 6158 ]
  149310. }
  149311. },
  149312. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_1": {
  149313. "hide_name": 0,
  149314. "type": "SB_LUT4",
  149315. "parameters": {
  149316. "LUT_INIT": "0110100110010110"
  149317. },
  149318. "attributes": {
  149319. "module_not_derived": "00000000000000000000000000000001",
  149320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149321. },
  149322. "port_directions": {
  149323. "I0": "input",
  149324. "I1": "input",
  149325. "I2": "input",
  149326. "I3": "input",
  149327. "O": "output"
  149328. },
  149329. "connections": {
  149330. "I0": [ "0" ],
  149331. "I1": [ 6152 ],
  149332. "I2": [ 6157 ],
  149333. "I3": [ 6155 ],
  149334. "O": [ 6160 ]
  149335. }
  149336. },
  149337. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_2": {
  149338. "hide_name": 0,
  149339. "type": "SB_LUT4",
  149340. "parameters": {
  149341. "LUT_INIT": "0110100110010110"
  149342. },
  149343. "attributes": {
  149344. "module_not_derived": "00000000000000000000000000000001",
  149345. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149346. },
  149347. "port_directions": {
  149348. "I0": "input",
  149349. "I1": "input",
  149350. "I2": "input",
  149351. "I3": "input",
  149352. "O": "output"
  149353. },
  149354. "connections": {
  149355. "I0": [ "0" ],
  149356. "I1": [ 6153 ],
  149357. "I2": [ 6157 ],
  149358. "I3": [ 6159 ],
  149359. "O": [ 6162 ]
  149360. }
  149361. },
  149362. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_3": {
  149363. "hide_name": 0,
  149364. "type": "SB_LUT4",
  149365. "parameters": {
  149366. "LUT_INIT": "0110100110010110"
  149367. },
  149368. "attributes": {
  149369. "module_not_derived": "00000000000000000000000000000001",
  149370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149371. },
  149372. "port_directions": {
  149373. "I0": "input",
  149374. "I1": "input",
  149375. "I2": "input",
  149376. "I3": "input",
  149377. "O": "output"
  149378. },
  149379. "connections": {
  149380. "I0": [ "0" ],
  149381. "I1": [ 6143 ],
  149382. "I2": [ 6157 ],
  149383. "I3": [ 6178 ],
  149384. "O": [ 6179 ]
  149385. }
  149386. },
  149387. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  149388. "hide_name": 0,
  149389. "type": "SB_CARRY",
  149390. "parameters": {
  149391. },
  149392. "attributes": {
  149393. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149394. },
  149395. "port_directions": {
  149396. "CI": "input",
  149397. "CO": "output",
  149398. "I0": "input",
  149399. "I1": "input"
  149400. },
  149401. "connections": {
  149402. "CI": [ 6156 ],
  149403. "CO": [ 6178 ],
  149404. "I0": [ 6151 ],
  149405. "I1": [ 6157 ]
  149406. }
  149407. },
  149408. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_4": {
  149409. "hide_name": 0,
  149410. "type": "SB_LUT4",
  149411. "parameters": {
  149412. "LUT_INIT": "0110100110010110"
  149413. },
  149414. "attributes": {
  149415. "module_not_derived": "00000000000000000000000000000001",
  149416. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149417. },
  149418. "port_directions": {
  149419. "I0": "input",
  149420. "I1": "input",
  149421. "I2": "input",
  149422. "I3": "input",
  149423. "O": "output"
  149424. },
  149425. "connections": {
  149426. "I0": [ "0" ],
  149427. "I1": [ 6141 ],
  149428. "I2": [ 6157 ],
  149429. "I3": [ 6175 ],
  149430. "O": [ 6177 ]
  149431. }
  149432. },
  149433. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_5": {
  149434. "hide_name": 0,
  149435. "type": "SB_LUT4",
  149436. "parameters": {
  149437. "LUT_INIT": "0110100110010110"
  149438. },
  149439. "attributes": {
  149440. "module_not_derived": "00000000000000000000000000000001",
  149441. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149442. },
  149443. "port_directions": {
  149444. "I0": "input",
  149445. "I1": "input",
  149446. "I2": "input",
  149447. "I3": "input",
  149448. "O": "output"
  149449. },
  149450. "connections": {
  149451. "I0": [ "0" ],
  149452. "I1": [ 6149 ],
  149453. "I2": [ 6157 ],
  149454. "I3": [ 6167 ],
  149455. "O": [ 6169 ]
  149456. }
  149457. },
  149458. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_6": {
  149459. "hide_name": 0,
  149460. "type": "SB_LUT4",
  149461. "parameters": {
  149462. "LUT_INIT": "0110100110010110"
  149463. },
  149464. "attributes": {
  149465. "module_not_derived": "00000000000000000000000000000001",
  149466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149467. },
  149468. "port_directions": {
  149469. "I0": "input",
  149470. "I1": "input",
  149471. "I2": "input",
  149472. "I3": "input",
  149473. "O": "output"
  149474. },
  149475. "connections": {
  149476. "I0": [ "0" ],
  149477. "I1": [ 6148 ],
  149478. "I2": [ 6157 ],
  149479. "I3": [ 6165 ],
  149480. "O": [ 6168 ]
  149481. }
  149482. },
  149483. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_7": {
  149484. "hide_name": 0,
  149485. "type": "SB_LUT4",
  149486. "parameters": {
  149487. "LUT_INIT": "0110100110010110"
  149488. },
  149489. "attributes": {
  149490. "module_not_derived": "00000000000000000000000000000001",
  149491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149492. },
  149493. "port_directions": {
  149494. "I0": "input",
  149495. "I1": "input",
  149496. "I2": "input",
  149497. "I3": "input",
  149498. "O": "output"
  149499. },
  149500. "connections": {
  149501. "I0": [ "0" ],
  149502. "I1": [ 6147 ],
  149503. "I2": [ 6157 ],
  149504. "I3": [ 6163 ],
  149505. "O": [ 6166 ]
  149506. }
  149507. },
  149508. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_8": {
  149509. "hide_name": 0,
  149510. "type": "SB_LUT4",
  149511. "parameters": {
  149512. "LUT_INIT": "0110100110010110"
  149513. },
  149514. "attributes": {
  149515. "module_not_derived": "00000000000000000000000000000001",
  149516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149517. },
  149518. "port_directions": {
  149519. "I0": "input",
  149520. "I1": "input",
  149521. "I2": "input",
  149522. "I3": "input",
  149523. "O": "output"
  149524. },
  149525. "connections": {
  149526. "I0": [ "0" ],
  149527. "I1": [ 6146 ],
  149528. "I2": [ 6157 ],
  149529. "I3": [ 6161 ],
  149530. "O": [ 6164 ]
  149531. }
  149532. },
  149533. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_O": {
  149534. "hide_name": 0,
  149535. "type": "SB_LUT4",
  149536. "parameters": {
  149537. "LUT_INIT": "0000111111110000"
  149538. },
  149539. "attributes": {
  149540. "module_not_derived": "00000000000000000000000000000001",
  149541. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  149542. },
  149543. "port_directions": {
  149544. "I0": "input",
  149545. "I1": "input",
  149546. "I2": "input",
  149547. "I3": "input",
  149548. "O": "output"
  149549. },
  149550. "connections": {
  149551. "I0": [ "0" ],
  149552. "I1": [ "0" ],
  149553. "I2": [ 6173 ],
  149554. "I3": [ 6174 ],
  149555. "O": [ 6176 ]
  149556. }
  149557. },
  149558. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0": {
  149559. "hide_name": 0,
  149560. "type": "SB_RAM40_4K",
  149561. "parameters": {
  149562. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149563. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149564. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149565. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149566. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149567. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149568. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149569. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149570. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149571. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149572. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149573. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149574. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149575. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149576. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149577. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  149578. "READ_MODE": "01",
  149579. "WRITE_MODE": "01"
  149580. },
  149581. "attributes": {
  149582. "module_not_derived": "00000000000000000000000000000001",
  149583. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  149584. },
  149585. "port_directions": {
  149586. "MASK": "input",
  149587. "RADDR": "input",
  149588. "RCLK": "input",
  149589. "RCLKE": "input",
  149590. "RDATA": "output",
  149591. "RE": "input",
  149592. "WADDR": "input",
  149593. "WCLK": "input",
  149594. "WCLKE": "input",
  149595. "WDATA": "input",
  149596. "WE": "input"
  149597. },
  149598. "connections": {
  149599. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  149600. "RADDR": [ 6180, 6181, 6182, 6183, 6184, 6185, 6186, 6187, 6188, "0", "0" ],
  149601. "RCLK": [ 42 ],
  149602. "RCLKE": [ 6174 ],
  149603. "RDATA": [ 6189, 6190, 6191, 6192, 6193, 6194, 6195, 6196, 6197, 6198, 6199, 6200, 6201, 6202, 6203, 6204 ],
  149604. "RE": [ "1" ],
  149605. "WADDR": [ 6205, 6206, 6207, 6208, 6209, 6210, 6211, 6212, 6213, "0", "0" ],
  149606. "WCLK": [ 42 ],
  149607. "WCLKE": [ 6173 ],
  149608. "WDATA": [ 6138, "0", 6134, "0", 6136, "0", 6132, "0", 6137, "0", 6133, "0", 6135, "0", 6131, "0" ],
  149609. "WE": [ "1" ]
  149610. }
  149611. },
  149612. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_1_SB_CARRY_I1": {
  149613. "hide_name": 0,
  149614. "type": "SB_CARRY",
  149615. "parameters": {
  149616. },
  149617. "attributes": {
  149618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149619. },
  149620. "port_directions": {
  149621. "CI": "input",
  149622. "CO": "output",
  149623. "I0": "input",
  149624. "I1": "input"
  149625. },
  149626. "connections": {
  149627. "CI": [ 6214 ],
  149628. "CO": [ 6215 ],
  149629. "I0": [ "0" ],
  149630. "I1": [ 6186 ]
  149631. }
  149632. },
  149633. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_1_SB_DFFER_Q": {
  149634. "hide_name": 0,
  149635. "type": "SB_DFFER",
  149636. "parameters": {
  149637. },
  149638. "attributes": {
  149639. "module_not_derived": "00000000000000000000000000000001",
  149640. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149641. },
  149642. "port_directions": {
  149643. "C": "input",
  149644. "D": "input",
  149645. "E": "input",
  149646. "Q": "output",
  149647. "R": "input"
  149648. },
  149649. "connections": {
  149650. "C": [ 42 ],
  149651. "D": [ 6216 ],
  149652. "E": [ 6174 ],
  149653. "Q": [ 6186 ],
  149654. "R": [ 127 ]
  149655. }
  149656. },
  149657. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_2_SB_CARRY_I1": {
  149658. "hide_name": 0,
  149659. "type": "SB_CARRY",
  149660. "parameters": {
  149661. },
  149662. "attributes": {
  149663. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149664. },
  149665. "port_directions": {
  149666. "CI": "input",
  149667. "CO": "output",
  149668. "I0": "input",
  149669. "I1": "input"
  149670. },
  149671. "connections": {
  149672. "CI": [ 6217 ],
  149673. "CO": [ 6214 ],
  149674. "I0": [ "0" ],
  149675. "I1": [ 6185 ]
  149676. }
  149677. },
  149678. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_2_SB_DFFER_Q": {
  149679. "hide_name": 0,
  149680. "type": "SB_DFFER",
  149681. "parameters": {
  149682. },
  149683. "attributes": {
  149684. "module_not_derived": "00000000000000000000000000000001",
  149685. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149686. },
  149687. "port_directions": {
  149688. "C": "input",
  149689. "D": "input",
  149690. "E": "input",
  149691. "Q": "output",
  149692. "R": "input"
  149693. },
  149694. "connections": {
  149695. "C": [ 42 ],
  149696. "D": [ 6218 ],
  149697. "E": [ 6174 ],
  149698. "Q": [ 6185 ],
  149699. "R": [ 127 ]
  149700. }
  149701. },
  149702. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_3_SB_CARRY_I1": {
  149703. "hide_name": 0,
  149704. "type": "SB_CARRY",
  149705. "parameters": {
  149706. },
  149707. "attributes": {
  149708. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149709. },
  149710. "port_directions": {
  149711. "CI": "input",
  149712. "CO": "output",
  149713. "I0": "input",
  149714. "I1": "input"
  149715. },
  149716. "connections": {
  149717. "CI": [ 6219 ],
  149718. "CO": [ 6217 ],
  149719. "I0": [ "0" ],
  149720. "I1": [ 6184 ]
  149721. }
  149722. },
  149723. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_3_SB_DFFER_Q": {
  149724. "hide_name": 0,
  149725. "type": "SB_DFFER",
  149726. "parameters": {
  149727. },
  149728. "attributes": {
  149729. "module_not_derived": "00000000000000000000000000000001",
  149730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149731. },
  149732. "port_directions": {
  149733. "C": "input",
  149734. "D": "input",
  149735. "E": "input",
  149736. "Q": "output",
  149737. "R": "input"
  149738. },
  149739. "connections": {
  149740. "C": [ 42 ],
  149741. "D": [ 6220 ],
  149742. "E": [ 6174 ],
  149743. "Q": [ 6184 ],
  149744. "R": [ 127 ]
  149745. }
  149746. },
  149747. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_4_SB_CARRY_I1": {
  149748. "hide_name": 0,
  149749. "type": "SB_CARRY",
  149750. "parameters": {
  149751. },
  149752. "attributes": {
  149753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149754. },
  149755. "port_directions": {
  149756. "CI": "input",
  149757. "CO": "output",
  149758. "I0": "input",
  149759. "I1": "input"
  149760. },
  149761. "connections": {
  149762. "CI": [ 6221 ],
  149763. "CO": [ 6219 ],
  149764. "I0": [ "0" ],
  149765. "I1": [ 6183 ]
  149766. }
  149767. },
  149768. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_4_SB_DFFER_Q": {
  149769. "hide_name": 0,
  149770. "type": "SB_DFFER",
  149771. "parameters": {
  149772. },
  149773. "attributes": {
  149774. "module_not_derived": "00000000000000000000000000000001",
  149775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149776. },
  149777. "port_directions": {
  149778. "C": "input",
  149779. "D": "input",
  149780. "E": "input",
  149781. "Q": "output",
  149782. "R": "input"
  149783. },
  149784. "connections": {
  149785. "C": [ 42 ],
  149786. "D": [ 6222 ],
  149787. "E": [ 6174 ],
  149788. "Q": [ 6183 ],
  149789. "R": [ 127 ]
  149790. }
  149791. },
  149792. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_5_SB_CARRY_I1": {
  149793. "hide_name": 0,
  149794. "type": "SB_CARRY",
  149795. "parameters": {
  149796. },
  149797. "attributes": {
  149798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149799. },
  149800. "port_directions": {
  149801. "CI": "input",
  149802. "CO": "output",
  149803. "I0": "input",
  149804. "I1": "input"
  149805. },
  149806. "connections": {
  149807. "CI": [ 6223 ],
  149808. "CO": [ 6221 ],
  149809. "I0": [ "0" ],
  149810. "I1": [ 6182 ]
  149811. }
  149812. },
  149813. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_5_SB_DFFER_Q": {
  149814. "hide_name": 0,
  149815. "type": "SB_DFFER",
  149816. "parameters": {
  149817. },
  149818. "attributes": {
  149819. "module_not_derived": "00000000000000000000000000000001",
  149820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149821. },
  149822. "port_directions": {
  149823. "C": "input",
  149824. "D": "input",
  149825. "E": "input",
  149826. "Q": "output",
  149827. "R": "input"
  149828. },
  149829. "connections": {
  149830. "C": [ 42 ],
  149831. "D": [ 6224 ],
  149832. "E": [ 6174 ],
  149833. "Q": [ 6182 ],
  149834. "R": [ 127 ]
  149835. }
  149836. },
  149837. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_6_SB_CARRY_I1": {
  149838. "hide_name": 0,
  149839. "type": "SB_CARRY",
  149840. "parameters": {
  149841. },
  149842. "attributes": {
  149843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149844. },
  149845. "port_directions": {
  149846. "CI": "input",
  149847. "CO": "output",
  149848. "I0": "input",
  149849. "I1": "input"
  149850. },
  149851. "connections": {
  149852. "CI": [ 6225 ],
  149853. "CO": [ 6223 ],
  149854. "I0": [ "0" ],
  149855. "I1": [ 6181 ]
  149856. }
  149857. },
  149858. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_6_SB_DFFER_Q": {
  149859. "hide_name": 0,
  149860. "type": "SB_DFFER",
  149861. "parameters": {
  149862. },
  149863. "attributes": {
  149864. "module_not_derived": "00000000000000000000000000000001",
  149865. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149866. },
  149867. "port_directions": {
  149868. "C": "input",
  149869. "D": "input",
  149870. "E": "input",
  149871. "Q": "output",
  149872. "R": "input"
  149873. },
  149874. "connections": {
  149875. "C": [ 42 ],
  149876. "D": [ 6226 ],
  149877. "E": [ 6174 ],
  149878. "Q": [ 6181 ],
  149879. "R": [ 127 ]
  149880. }
  149881. },
  149882. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_7_SB_CARRY_I1": {
  149883. "hide_name": 0,
  149884. "type": "SB_CARRY",
  149885. "parameters": {
  149886. },
  149887. "attributes": {
  149888. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  149889. },
  149890. "port_directions": {
  149891. "CI": "input",
  149892. "CO": "output",
  149893. "I0": "input",
  149894. "I1": "input"
  149895. },
  149896. "connections": {
  149897. "CI": [ 6188 ],
  149898. "CO": [ 6225 ],
  149899. "I0": [ "0" ],
  149900. "I1": [ 6180 ]
  149901. }
  149902. },
  149903. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_7_SB_DFFER_Q": {
  149904. "hide_name": 0,
  149905. "type": "SB_DFFER",
  149906. "parameters": {
  149907. },
  149908. "attributes": {
  149909. "module_not_derived": "00000000000000000000000000000001",
  149910. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149911. },
  149912. "port_directions": {
  149913. "C": "input",
  149914. "D": "input",
  149915. "E": "input",
  149916. "Q": "output",
  149917. "R": "input"
  149918. },
  149919. "connections": {
  149920. "C": [ 42 ],
  149921. "D": [ 6227 ],
  149922. "E": [ 6174 ],
  149923. "Q": [ 6180 ],
  149924. "R": [ 127 ]
  149925. }
  149926. },
  149927. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_8_SB_DFFER_Q": {
  149928. "hide_name": 0,
  149929. "type": "SB_DFFER",
  149930. "parameters": {
  149931. },
  149932. "attributes": {
  149933. "module_not_derived": "00000000000000000000000000000001",
  149934. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149935. },
  149936. "port_directions": {
  149937. "C": "input",
  149938. "D": "input",
  149939. "E": "input",
  149940. "Q": "output",
  149941. "R": "input"
  149942. },
  149943. "connections": {
  149944. "C": [ 42 ],
  149945. "D": [ 6228 ],
  149946. "E": [ 6174 ],
  149947. "Q": [ 6188 ],
  149948. "R": [ 127 ]
  149949. }
  149950. },
  149951. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_DFFER_Q": {
  149952. "hide_name": 0,
  149953. "type": "SB_DFFER",
  149954. "parameters": {
  149955. },
  149956. "attributes": {
  149957. "module_not_derived": "00000000000000000000000000000001",
  149958. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  149959. },
  149960. "port_directions": {
  149961. "C": "input",
  149962. "D": "input",
  149963. "E": "input",
  149964. "Q": "output",
  149965. "R": "input"
  149966. },
  149967. "connections": {
  149968. "C": [ 42 ],
  149969. "D": [ 6229 ],
  149970. "E": [ 6174 ],
  149971. "Q": [ 6187 ],
  149972. "R": [ 127 ]
  149973. }
  149974. },
  149975. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2": {
  149976. "hide_name": 0,
  149977. "type": "SB_LUT4",
  149978. "parameters": {
  149979. "LUT_INIT": "0110100110010110"
  149980. },
  149981. "attributes": {
  149982. "module_not_derived": "00000000000000000000000000000001",
  149983. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  149984. },
  149985. "port_directions": {
  149986. "I0": "input",
  149987. "I1": "input",
  149988. "I2": "input",
  149989. "I3": "input",
  149990. "O": "output"
  149991. },
  149992. "connections": {
  149993. "I0": [ "0" ],
  149994. "I1": [ "0" ],
  149995. "I2": [ 6187 ],
  149996. "I3": [ 6215 ],
  149997. "O": [ 6229 ]
  149998. }
  149999. },
  150000. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O": {
  150001. "hide_name": 0,
  150002. "type": "SB_LUT4",
  150003. "parameters": {
  150004. "LUT_INIT": "0110100110010110"
  150005. },
  150006. "attributes": {
  150007. "module_not_derived": "00000000000000000000000000000001",
  150008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150009. },
  150010. "port_directions": {
  150011. "I0": "input",
  150012. "I1": "input",
  150013. "I2": "input",
  150014. "I3": "input",
  150015. "O": "output"
  150016. },
  150017. "connections": {
  150018. "I0": [ "0" ],
  150019. "I1": [ "0" ],
  150020. "I2": [ 6180 ],
  150021. "I3": [ 6188 ],
  150022. "O": [ 6227 ]
  150023. }
  150024. },
  150025. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_1": {
  150026. "hide_name": 0,
  150027. "type": "SB_LUT4",
  150028. "parameters": {
  150029. "LUT_INIT": "0110100110010110"
  150030. },
  150031. "attributes": {
  150032. "module_not_derived": "00000000000000000000000000000001",
  150033. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150034. },
  150035. "port_directions": {
  150036. "I0": "input",
  150037. "I1": "input",
  150038. "I2": "input",
  150039. "I3": "input",
  150040. "O": "output"
  150041. },
  150042. "connections": {
  150043. "I0": [ "0" ],
  150044. "I1": [ "0" ],
  150045. "I2": [ 6181 ],
  150046. "I3": [ 6225 ],
  150047. "O": [ 6226 ]
  150048. }
  150049. },
  150050. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_2": {
  150051. "hide_name": 0,
  150052. "type": "SB_LUT4",
  150053. "parameters": {
  150054. "LUT_INIT": "0110100110010110"
  150055. },
  150056. "attributes": {
  150057. "module_not_derived": "00000000000000000000000000000001",
  150058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150059. },
  150060. "port_directions": {
  150061. "I0": "input",
  150062. "I1": "input",
  150063. "I2": "input",
  150064. "I3": "input",
  150065. "O": "output"
  150066. },
  150067. "connections": {
  150068. "I0": [ "0" ],
  150069. "I1": [ "0" ],
  150070. "I2": [ 6182 ],
  150071. "I3": [ 6223 ],
  150072. "O": [ 6224 ]
  150073. }
  150074. },
  150075. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_3": {
  150076. "hide_name": 0,
  150077. "type": "SB_LUT4",
  150078. "parameters": {
  150079. "LUT_INIT": "0110100110010110"
  150080. },
  150081. "attributes": {
  150082. "module_not_derived": "00000000000000000000000000000001",
  150083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150084. },
  150085. "port_directions": {
  150086. "I0": "input",
  150087. "I1": "input",
  150088. "I2": "input",
  150089. "I3": "input",
  150090. "O": "output"
  150091. },
  150092. "connections": {
  150093. "I0": [ "0" ],
  150094. "I1": [ "0" ],
  150095. "I2": [ 6183 ],
  150096. "I3": [ 6221 ],
  150097. "O": [ 6222 ]
  150098. }
  150099. },
  150100. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_4": {
  150101. "hide_name": 0,
  150102. "type": "SB_LUT4",
  150103. "parameters": {
  150104. "LUT_INIT": "0110100110010110"
  150105. },
  150106. "attributes": {
  150107. "module_not_derived": "00000000000000000000000000000001",
  150108. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150109. },
  150110. "port_directions": {
  150111. "I0": "input",
  150112. "I1": "input",
  150113. "I2": "input",
  150114. "I3": "input",
  150115. "O": "output"
  150116. },
  150117. "connections": {
  150118. "I0": [ "0" ],
  150119. "I1": [ "0" ],
  150120. "I2": [ 6184 ],
  150121. "I3": [ 6219 ],
  150122. "O": [ 6220 ]
  150123. }
  150124. },
  150125. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_5": {
  150126. "hide_name": 0,
  150127. "type": "SB_LUT4",
  150128. "parameters": {
  150129. "LUT_INIT": "0110100110010110"
  150130. },
  150131. "attributes": {
  150132. "module_not_derived": "00000000000000000000000000000001",
  150133. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150134. },
  150135. "port_directions": {
  150136. "I0": "input",
  150137. "I1": "input",
  150138. "I2": "input",
  150139. "I3": "input",
  150140. "O": "output"
  150141. },
  150142. "connections": {
  150143. "I0": [ "0" ],
  150144. "I1": [ "0" ],
  150145. "I2": [ 6185 ],
  150146. "I3": [ 6217 ],
  150147. "O": [ 6218 ]
  150148. }
  150149. },
  150150. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_6": {
  150151. "hide_name": 0,
  150152. "type": "SB_LUT4",
  150153. "parameters": {
  150154. "LUT_INIT": "0110100110010110"
  150155. },
  150156. "attributes": {
  150157. "module_not_derived": "00000000000000000000000000000001",
  150158. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150159. },
  150160. "port_directions": {
  150161. "I0": "input",
  150162. "I1": "input",
  150163. "I2": "input",
  150164. "I3": "input",
  150165. "O": "output"
  150166. },
  150167. "connections": {
  150168. "I0": [ "0" ],
  150169. "I1": [ "0" ],
  150170. "I2": [ 6186 ],
  150171. "I3": [ 6214 ],
  150172. "O": [ 6216 ]
  150173. }
  150174. },
  150175. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_7": {
  150176. "hide_name": 0,
  150177. "type": "SB_LUT4",
  150178. "parameters": {
  150179. "LUT_INIT": "0000000011111111"
  150180. },
  150181. "attributes": {
  150182. "module_not_derived": "00000000000000000000000000000001",
  150183. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  150184. },
  150185. "port_directions": {
  150186. "I0": "input",
  150187. "I1": "input",
  150188. "I2": "input",
  150189. "I3": "input",
  150190. "O": "output"
  150191. },
  150192. "connections": {
  150193. "I0": [ "0" ],
  150194. "I1": [ "0" ],
  150195. "I2": [ "0" ],
  150196. "I3": [ 6188 ],
  150197. "O": [ 6228 ]
  150198. }
  150199. },
  150200. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_1_SB_CARRY_I1": {
  150201. "hide_name": 0,
  150202. "type": "SB_CARRY",
  150203. "parameters": {
  150204. },
  150205. "attributes": {
  150206. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150207. },
  150208. "port_directions": {
  150209. "CI": "input",
  150210. "CO": "output",
  150211. "I0": "input",
  150212. "I1": "input"
  150213. },
  150214. "connections": {
  150215. "CI": [ 6230 ],
  150216. "CO": [ 6231 ],
  150217. "I0": [ "0" ],
  150218. "I1": [ 6211 ]
  150219. }
  150220. },
  150221. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_1_SB_DFFER_Q": {
  150222. "hide_name": 0,
  150223. "type": "SB_DFFER",
  150224. "parameters": {
  150225. },
  150226. "attributes": {
  150227. "module_not_derived": "00000000000000000000000000000001",
  150228. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150229. },
  150230. "port_directions": {
  150231. "C": "input",
  150232. "D": "input",
  150233. "E": "input",
  150234. "Q": "output",
  150235. "R": "input"
  150236. },
  150237. "connections": {
  150238. "C": [ 42 ],
  150239. "D": [ 6232 ],
  150240. "E": [ 6173 ],
  150241. "Q": [ 6211 ],
  150242. "R": [ 127 ]
  150243. }
  150244. },
  150245. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_2_SB_CARRY_I1": {
  150246. "hide_name": 0,
  150247. "type": "SB_CARRY",
  150248. "parameters": {
  150249. },
  150250. "attributes": {
  150251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150252. },
  150253. "port_directions": {
  150254. "CI": "input",
  150255. "CO": "output",
  150256. "I0": "input",
  150257. "I1": "input"
  150258. },
  150259. "connections": {
  150260. "CI": [ 6233 ],
  150261. "CO": [ 6230 ],
  150262. "I0": [ "0" ],
  150263. "I1": [ 6210 ]
  150264. }
  150265. },
  150266. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_2_SB_DFFER_Q": {
  150267. "hide_name": 0,
  150268. "type": "SB_DFFER",
  150269. "parameters": {
  150270. },
  150271. "attributes": {
  150272. "module_not_derived": "00000000000000000000000000000001",
  150273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150274. },
  150275. "port_directions": {
  150276. "C": "input",
  150277. "D": "input",
  150278. "E": "input",
  150279. "Q": "output",
  150280. "R": "input"
  150281. },
  150282. "connections": {
  150283. "C": [ 42 ],
  150284. "D": [ 6234 ],
  150285. "E": [ 6173 ],
  150286. "Q": [ 6210 ],
  150287. "R": [ 127 ]
  150288. }
  150289. },
  150290. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_3_SB_CARRY_I1": {
  150291. "hide_name": 0,
  150292. "type": "SB_CARRY",
  150293. "parameters": {
  150294. },
  150295. "attributes": {
  150296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150297. },
  150298. "port_directions": {
  150299. "CI": "input",
  150300. "CO": "output",
  150301. "I0": "input",
  150302. "I1": "input"
  150303. },
  150304. "connections": {
  150305. "CI": [ 6235 ],
  150306. "CO": [ 6233 ],
  150307. "I0": [ "0" ],
  150308. "I1": [ 6209 ]
  150309. }
  150310. },
  150311. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_3_SB_DFFER_Q": {
  150312. "hide_name": 0,
  150313. "type": "SB_DFFER",
  150314. "parameters": {
  150315. },
  150316. "attributes": {
  150317. "module_not_derived": "00000000000000000000000000000001",
  150318. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150319. },
  150320. "port_directions": {
  150321. "C": "input",
  150322. "D": "input",
  150323. "E": "input",
  150324. "Q": "output",
  150325. "R": "input"
  150326. },
  150327. "connections": {
  150328. "C": [ 42 ],
  150329. "D": [ 6236 ],
  150330. "E": [ 6173 ],
  150331. "Q": [ 6209 ],
  150332. "R": [ 127 ]
  150333. }
  150334. },
  150335. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_4_SB_CARRY_I1": {
  150336. "hide_name": 0,
  150337. "type": "SB_CARRY",
  150338. "parameters": {
  150339. },
  150340. "attributes": {
  150341. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150342. },
  150343. "port_directions": {
  150344. "CI": "input",
  150345. "CO": "output",
  150346. "I0": "input",
  150347. "I1": "input"
  150348. },
  150349. "connections": {
  150350. "CI": [ 6237 ],
  150351. "CO": [ 6235 ],
  150352. "I0": [ "0" ],
  150353. "I1": [ 6208 ]
  150354. }
  150355. },
  150356. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_4_SB_DFFER_Q": {
  150357. "hide_name": 0,
  150358. "type": "SB_DFFER",
  150359. "parameters": {
  150360. },
  150361. "attributes": {
  150362. "module_not_derived": "00000000000000000000000000000001",
  150363. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150364. },
  150365. "port_directions": {
  150366. "C": "input",
  150367. "D": "input",
  150368. "E": "input",
  150369. "Q": "output",
  150370. "R": "input"
  150371. },
  150372. "connections": {
  150373. "C": [ 42 ],
  150374. "D": [ 6238 ],
  150375. "E": [ 6173 ],
  150376. "Q": [ 6208 ],
  150377. "R": [ 127 ]
  150378. }
  150379. },
  150380. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_5_SB_CARRY_I1": {
  150381. "hide_name": 0,
  150382. "type": "SB_CARRY",
  150383. "parameters": {
  150384. },
  150385. "attributes": {
  150386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150387. },
  150388. "port_directions": {
  150389. "CI": "input",
  150390. "CO": "output",
  150391. "I0": "input",
  150392. "I1": "input"
  150393. },
  150394. "connections": {
  150395. "CI": [ 6239 ],
  150396. "CO": [ 6237 ],
  150397. "I0": [ "0" ],
  150398. "I1": [ 6207 ]
  150399. }
  150400. },
  150401. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_5_SB_DFFER_Q": {
  150402. "hide_name": 0,
  150403. "type": "SB_DFFER",
  150404. "parameters": {
  150405. },
  150406. "attributes": {
  150407. "module_not_derived": "00000000000000000000000000000001",
  150408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150409. },
  150410. "port_directions": {
  150411. "C": "input",
  150412. "D": "input",
  150413. "E": "input",
  150414. "Q": "output",
  150415. "R": "input"
  150416. },
  150417. "connections": {
  150418. "C": [ 42 ],
  150419. "D": [ 6240 ],
  150420. "E": [ 6173 ],
  150421. "Q": [ 6207 ],
  150422. "R": [ 127 ]
  150423. }
  150424. },
  150425. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_6_SB_CARRY_I1": {
  150426. "hide_name": 0,
  150427. "type": "SB_CARRY",
  150428. "parameters": {
  150429. },
  150430. "attributes": {
  150431. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150432. },
  150433. "port_directions": {
  150434. "CI": "input",
  150435. "CO": "output",
  150436. "I0": "input",
  150437. "I1": "input"
  150438. },
  150439. "connections": {
  150440. "CI": [ 6241 ],
  150441. "CO": [ 6239 ],
  150442. "I0": [ "0" ],
  150443. "I1": [ 6206 ]
  150444. }
  150445. },
  150446. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_6_SB_DFFER_Q": {
  150447. "hide_name": 0,
  150448. "type": "SB_DFFER",
  150449. "parameters": {
  150450. },
  150451. "attributes": {
  150452. "module_not_derived": "00000000000000000000000000000001",
  150453. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150454. },
  150455. "port_directions": {
  150456. "C": "input",
  150457. "D": "input",
  150458. "E": "input",
  150459. "Q": "output",
  150460. "R": "input"
  150461. },
  150462. "connections": {
  150463. "C": [ 42 ],
  150464. "D": [ 6242 ],
  150465. "E": [ 6173 ],
  150466. "Q": [ 6206 ],
  150467. "R": [ 127 ]
  150468. }
  150469. },
  150470. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_7_SB_CARRY_I1": {
  150471. "hide_name": 0,
  150472. "type": "SB_CARRY",
  150473. "parameters": {
  150474. },
  150475. "attributes": {
  150476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  150477. },
  150478. "port_directions": {
  150479. "CI": "input",
  150480. "CO": "output",
  150481. "I0": "input",
  150482. "I1": "input"
  150483. },
  150484. "connections": {
  150485. "CI": [ 6213 ],
  150486. "CO": [ 6241 ],
  150487. "I0": [ "0" ],
  150488. "I1": [ 6205 ]
  150489. }
  150490. },
  150491. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_7_SB_DFFER_Q": {
  150492. "hide_name": 0,
  150493. "type": "SB_DFFER",
  150494. "parameters": {
  150495. },
  150496. "attributes": {
  150497. "module_not_derived": "00000000000000000000000000000001",
  150498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150499. },
  150500. "port_directions": {
  150501. "C": "input",
  150502. "D": "input",
  150503. "E": "input",
  150504. "Q": "output",
  150505. "R": "input"
  150506. },
  150507. "connections": {
  150508. "C": [ 42 ],
  150509. "D": [ 6243 ],
  150510. "E": [ 6173 ],
  150511. "Q": [ 6205 ],
  150512. "R": [ 127 ]
  150513. }
  150514. },
  150515. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_8_SB_DFFER_Q": {
  150516. "hide_name": 0,
  150517. "type": "SB_DFFER",
  150518. "parameters": {
  150519. },
  150520. "attributes": {
  150521. "module_not_derived": "00000000000000000000000000000001",
  150522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150523. },
  150524. "port_directions": {
  150525. "C": "input",
  150526. "D": "input",
  150527. "E": "input",
  150528. "Q": "output",
  150529. "R": "input"
  150530. },
  150531. "connections": {
  150532. "C": [ 42 ],
  150533. "D": [ 6244 ],
  150534. "E": [ 6173 ],
  150535. "Q": [ 6213 ],
  150536. "R": [ 127 ]
  150537. }
  150538. },
  150539. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_DFFER_Q": {
  150540. "hide_name": 0,
  150541. "type": "SB_DFFER",
  150542. "parameters": {
  150543. },
  150544. "attributes": {
  150545. "module_not_derived": "00000000000000000000000000000001",
  150546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  150547. },
  150548. "port_directions": {
  150549. "C": "input",
  150550. "D": "input",
  150551. "E": "input",
  150552. "Q": "output",
  150553. "R": "input"
  150554. },
  150555. "connections": {
  150556. "C": [ 42 ],
  150557. "D": [ 6245 ],
  150558. "E": [ 6173 ],
  150559. "Q": [ 6212 ],
  150560. "R": [ 127 ]
  150561. }
  150562. },
  150563. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2": {
  150564. "hide_name": 0,
  150565. "type": "SB_LUT4",
  150566. "parameters": {
  150567. "LUT_INIT": "0110100110010110"
  150568. },
  150569. "attributes": {
  150570. "module_not_derived": "00000000000000000000000000000001",
  150571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150572. },
  150573. "port_directions": {
  150574. "I0": "input",
  150575. "I1": "input",
  150576. "I2": "input",
  150577. "I3": "input",
  150578. "O": "output"
  150579. },
  150580. "connections": {
  150581. "I0": [ "0" ],
  150582. "I1": [ "0" ],
  150583. "I2": [ 6212 ],
  150584. "I3": [ 6231 ],
  150585. "O": [ 6245 ]
  150586. }
  150587. },
  150588. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O": {
  150589. "hide_name": 0,
  150590. "type": "SB_LUT4",
  150591. "parameters": {
  150592. "LUT_INIT": "0110100110010110"
  150593. },
  150594. "attributes": {
  150595. "module_not_derived": "00000000000000000000000000000001",
  150596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150597. },
  150598. "port_directions": {
  150599. "I0": "input",
  150600. "I1": "input",
  150601. "I2": "input",
  150602. "I3": "input",
  150603. "O": "output"
  150604. },
  150605. "connections": {
  150606. "I0": [ "0" ],
  150607. "I1": [ "0" ],
  150608. "I2": [ 6206 ],
  150609. "I3": [ 6241 ],
  150610. "O": [ 6242 ]
  150611. }
  150612. },
  150613. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_1": {
  150614. "hide_name": 0,
  150615. "type": "SB_LUT4",
  150616. "parameters": {
  150617. "LUT_INIT": "0110100110010110"
  150618. },
  150619. "attributes": {
  150620. "module_not_derived": "00000000000000000000000000000001",
  150621. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150622. },
  150623. "port_directions": {
  150624. "I0": "input",
  150625. "I1": "input",
  150626. "I2": "input",
  150627. "I3": "input",
  150628. "O": "output"
  150629. },
  150630. "connections": {
  150631. "I0": [ "0" ],
  150632. "I1": [ "0" ],
  150633. "I2": [ 6205 ],
  150634. "I3": [ 6213 ],
  150635. "O": [ 6243 ]
  150636. }
  150637. },
  150638. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_2": {
  150639. "hide_name": 0,
  150640. "type": "SB_LUT4",
  150641. "parameters": {
  150642. "LUT_INIT": "0110100110010110"
  150643. },
  150644. "attributes": {
  150645. "module_not_derived": "00000000000000000000000000000001",
  150646. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150647. },
  150648. "port_directions": {
  150649. "I0": "input",
  150650. "I1": "input",
  150651. "I2": "input",
  150652. "I3": "input",
  150653. "O": "output"
  150654. },
  150655. "connections": {
  150656. "I0": [ "0" ],
  150657. "I1": [ "0" ],
  150658. "I2": [ 6207 ],
  150659. "I3": [ 6239 ],
  150660. "O": [ 6240 ]
  150661. }
  150662. },
  150663. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_3": {
  150664. "hide_name": 0,
  150665. "type": "SB_LUT4",
  150666. "parameters": {
  150667. "LUT_INIT": "0110100110010110"
  150668. },
  150669. "attributes": {
  150670. "module_not_derived": "00000000000000000000000000000001",
  150671. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150672. },
  150673. "port_directions": {
  150674. "I0": "input",
  150675. "I1": "input",
  150676. "I2": "input",
  150677. "I3": "input",
  150678. "O": "output"
  150679. },
  150680. "connections": {
  150681. "I0": [ "0" ],
  150682. "I1": [ "0" ],
  150683. "I2": [ 6208 ],
  150684. "I3": [ 6237 ],
  150685. "O": [ 6238 ]
  150686. }
  150687. },
  150688. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_4": {
  150689. "hide_name": 0,
  150690. "type": "SB_LUT4",
  150691. "parameters": {
  150692. "LUT_INIT": "0110100110010110"
  150693. },
  150694. "attributes": {
  150695. "module_not_derived": "00000000000000000000000000000001",
  150696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150697. },
  150698. "port_directions": {
  150699. "I0": "input",
  150700. "I1": "input",
  150701. "I2": "input",
  150702. "I3": "input",
  150703. "O": "output"
  150704. },
  150705. "connections": {
  150706. "I0": [ "0" ],
  150707. "I1": [ "0" ],
  150708. "I2": [ 6209 ],
  150709. "I3": [ 6235 ],
  150710. "O": [ 6236 ]
  150711. }
  150712. },
  150713. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_5": {
  150714. "hide_name": 0,
  150715. "type": "SB_LUT4",
  150716. "parameters": {
  150717. "LUT_INIT": "0110100110010110"
  150718. },
  150719. "attributes": {
  150720. "module_not_derived": "00000000000000000000000000000001",
  150721. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150722. },
  150723. "port_directions": {
  150724. "I0": "input",
  150725. "I1": "input",
  150726. "I2": "input",
  150727. "I3": "input",
  150728. "O": "output"
  150729. },
  150730. "connections": {
  150731. "I0": [ "0" ],
  150732. "I1": [ "0" ],
  150733. "I2": [ 6210 ],
  150734. "I3": [ 6233 ],
  150735. "O": [ 6234 ]
  150736. }
  150737. },
  150738. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_6": {
  150739. "hide_name": 0,
  150740. "type": "SB_LUT4",
  150741. "parameters": {
  150742. "LUT_INIT": "0110100110010110"
  150743. },
  150744. "attributes": {
  150745. "module_not_derived": "00000000000000000000000000000001",
  150746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150747. },
  150748. "port_directions": {
  150749. "I0": "input",
  150750. "I1": "input",
  150751. "I2": "input",
  150752. "I3": "input",
  150753. "O": "output"
  150754. },
  150755. "connections": {
  150756. "I0": [ "0" ],
  150757. "I1": [ "0" ],
  150758. "I2": [ 6211 ],
  150759. "I3": [ 6230 ],
  150760. "O": [ 6232 ]
  150761. }
  150762. },
  150763. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_7": {
  150764. "hide_name": 0,
  150765. "type": "SB_LUT4",
  150766. "parameters": {
  150767. "LUT_INIT": "0000000011111111"
  150768. },
  150769. "attributes": {
  150770. "module_not_derived": "00000000000000000000000000000001",
  150771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  150772. },
  150773. "port_directions": {
  150774. "I0": "input",
  150775. "I1": "input",
  150776. "I2": "input",
  150777. "I3": "input",
  150778. "O": "output"
  150779. },
  150780. "connections": {
  150781. "I0": [ "0" ],
  150782. "I1": [ "0" ],
  150783. "I2": [ "0" ],
  150784. "I3": [ 6213 ],
  150785. "O": [ 6244 ]
  150786. }
  150787. },
  150788. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I1": {
  150789. "hide_name": 0,
  150790. "type": "SB_LUT4",
  150791. "parameters": {
  150792. "LUT_INIT": "1111000011001100"
  150793. },
  150794. "attributes": {
  150795. "module_not_derived": "00000000000000000000000000000001",
  150796. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150797. },
  150798. "port_directions": {
  150799. "I0": "input",
  150800. "I1": "input",
  150801. "I2": "input",
  150802. "I3": "input",
  150803. "O": "output"
  150804. },
  150805. "connections": {
  150806. "I0": [ "0" ],
  150807. "I1": [ 6203 ],
  150808. "I2": [ 6017 ],
  150809. "I3": [ 706 ],
  150810. "O": [ 6246 ]
  150811. }
  150812. },
  150813. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2": {
  150814. "hide_name": 0,
  150815. "type": "SB_LUT4",
  150816. "parameters": {
  150817. "LUT_INIT": "1100110011110000"
  150818. },
  150819. "attributes": {
  150820. "module_not_derived": "00000000000000000000000000000001",
  150821. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150822. },
  150823. "port_directions": {
  150824. "I0": "input",
  150825. "I1": "input",
  150826. "I2": "input",
  150827. "I3": "input",
  150828. "O": "output"
  150829. },
  150830. "connections": {
  150831. "I0": [ "0" ],
  150832. "I1": [ 6013 ],
  150833. "I2": [ 6197 ],
  150834. "I3": [ 706 ],
  150835. "O": [ 6247 ]
  150836. }
  150837. },
  150838. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2_1": {
  150839. "hide_name": 0,
  150840. "type": "SB_LUT4",
  150841. "parameters": {
  150842. "LUT_INIT": "1100110011110000"
  150843. },
  150844. "attributes": {
  150845. "module_not_derived": "00000000000000000000000000000001",
  150846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150847. },
  150848. "port_directions": {
  150849. "I0": "input",
  150850. "I1": "input",
  150851. "I2": "input",
  150852. "I3": "input",
  150853. "O": "output"
  150854. },
  150855. "connections": {
  150856. "I0": [ "0" ],
  150857. "I1": [ 6022 ],
  150858. "I2": [ 6193 ],
  150859. "I3": [ 706 ],
  150860. "O": [ 6248 ]
  150861. }
  150862. },
  150863. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2_2": {
  150864. "hide_name": 0,
  150865. "type": "SB_LUT4",
  150866. "parameters": {
  150867. "LUT_INIT": "1100110011110000"
  150868. },
  150869. "attributes": {
  150870. "module_not_derived": "00000000000000000000000000000001",
  150871. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150872. },
  150873. "port_directions": {
  150874. "I0": "input",
  150875. "I1": "input",
  150876. "I2": "input",
  150877. "I3": "input",
  150878. "O": "output"
  150879. },
  150880. "connections": {
  150881. "I0": [ "0" ],
  150882. "I1": [ 6021 ],
  150883. "I2": [ 6201 ],
  150884. "I3": [ 706 ],
  150885. "O": [ 6249 ]
  150886. }
  150887. },
  150888. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2_3": {
  150889. "hide_name": 0,
  150890. "type": "SB_LUT4",
  150891. "parameters": {
  150892. "LUT_INIT": "1100110011110000"
  150893. },
  150894. "attributes": {
  150895. "module_not_derived": "00000000000000000000000000000001",
  150896. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150897. },
  150898. "port_directions": {
  150899. "I0": "input",
  150900. "I1": "input",
  150901. "I2": "input",
  150902. "I3": "input",
  150903. "O": "output"
  150904. },
  150905. "connections": {
  150906. "I0": [ "0" ],
  150907. "I1": [ 6020 ],
  150908. "I2": [ 6191 ],
  150909. "I3": [ 706 ],
  150910. "O": [ 6250 ]
  150911. }
  150912. },
  150913. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2_4": {
  150914. "hide_name": 0,
  150915. "type": "SB_LUT4",
  150916. "parameters": {
  150917. "LUT_INIT": "1100110011110000"
  150918. },
  150919. "attributes": {
  150920. "module_not_derived": "00000000000000000000000000000001",
  150921. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150922. },
  150923. "port_directions": {
  150924. "I0": "input",
  150925. "I1": "input",
  150926. "I2": "input",
  150927. "I3": "input",
  150928. "O": "output"
  150929. },
  150930. "connections": {
  150931. "I0": [ "0" ],
  150932. "I1": [ 6019 ],
  150933. "I2": [ 6199 ],
  150934. "I3": [ 706 ],
  150935. "O": [ 6251 ]
  150936. }
  150937. },
  150938. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2_5": {
  150939. "hide_name": 0,
  150940. "type": "SB_LUT4",
  150941. "parameters": {
  150942. "LUT_INIT": "1100110011110000"
  150943. },
  150944. "attributes": {
  150945. "module_not_derived": "00000000000000000000000000000001",
  150946. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150947. },
  150948. "port_directions": {
  150949. "I0": "input",
  150950. "I1": "input",
  150951. "I2": "input",
  150952. "I3": "input",
  150953. "O": "output"
  150954. },
  150955. "connections": {
  150956. "I0": [ "0" ],
  150957. "I1": [ 6018 ],
  150958. "I2": [ 6195 ],
  150959. "I3": [ 706 ],
  150960. "O": [ 6252 ]
  150961. }
  150962. },
  150963. "uart_I.uart_rx_fifo_I.ram_I.rd_data_SB_LUT4_I2_6": {
  150964. "hide_name": 0,
  150965. "type": "SB_LUT4",
  150966. "parameters": {
  150967. "LUT_INIT": "1111110000110000"
  150968. },
  150969. "attributes": {
  150970. "module_not_derived": "00000000000000000000000000000001",
  150971. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  150972. },
  150973. "port_directions": {
  150974. "I0": "input",
  150975. "I1": "input",
  150976. "I2": "input",
  150977. "I3": "input",
  150978. "O": "output"
  150979. },
  150980. "connections": {
  150981. "I0": [ "0" ],
  150982. "I1": [ 706 ],
  150983. "I2": [ 6189 ],
  150984. "I3": [ 6014 ],
  150985. "O": [ 6253 ]
  150986. }
  150987. },
  150988. "uart_I.uart_rx_fifo_I.ram_rd_ena_SB_LUT4_O": {
  150989. "hide_name": 0,
  150990. "type": "SB_LUT4",
  150991. "parameters": {
  150992. "LUT_INIT": "0000000001001111"
  150993. },
  150994. "attributes": {
  150995. "module_not_derived": "00000000000000000000000000000001",
  150996. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  150997. },
  150998. "port_directions": {
  150999. "I0": "input",
  151000. "I1": "input",
  151001. "I2": "input",
  151002. "I3": "input",
  151003. "O": "output"
  151004. },
  151005. "connections": {
  151006. "I0": [ 6254 ],
  151007. "I1": [ 6255 ],
  151008. "I2": [ 6256 ],
  151009. "I3": [ 6143 ],
  151010. "O": [ 6174 ]
  151011. }
  151012. },
  151013. "uart_I.uart_rx_fifo_I.ram_wr_ena_SB_LUT4_O": {
  151014. "hide_name": 0,
  151015. "type": "SB_LUT4",
  151016. "parameters": {
  151017. "LUT_INIT": "0000000011110000"
  151018. },
  151019. "attributes": {
  151020. "module_not_derived": "00000000000000000000000000000001",
  151021. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  151022. },
  151023. "port_directions": {
  151024. "I0": "input",
  151025. "I1": "input",
  151026. "I2": "input",
  151027. "I3": "input",
  151028. "O": "output"
  151029. },
  151030. "connections": {
  151031. "I0": [ "0" ],
  151032. "I1": [ "0" ],
  151033. "I2": [ 6140 ],
  151034. "I3": [ 6170 ],
  151035. "O": [ 6173 ]
  151036. }
  151037. },
  151038. "uart_I.uart_tx_I.ack_SB_DFF_Q": {
  151039. "hide_name": 0,
  151040. "type": "SB_DFF",
  151041. "parameters": {
  151042. },
  151043. "attributes": {
  151044. "module_not_derived": "00000000000000000000000000000001",
  151045. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:67.2-68.13|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  151046. },
  151047. "port_directions": {
  151048. "C": "input",
  151049. "D": "input",
  151050. "Q": "output"
  151051. },
  151052. "connections": {
  151053. "C": [ 42 ],
  151054. "D": [ 6257 ],
  151055. "Q": [ 6258 ]
  151056. }
  151057. },
  151058. "uart_I.uart_tx_I.ack_SB_LUT4_I1": {
  151059. "hide_name": 0,
  151060. "type": "SB_LUT4",
  151061. "parameters": {
  151062. "LUT_INIT": "0011000011111111"
  151063. },
  151064. "attributes": {
  151065. "module_not_derived": "00000000000000000000000000000001",
  151066. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151067. },
  151068. "port_directions": {
  151069. "I0": "input",
  151070. "I1": "input",
  151071. "I2": "input",
  151072. "I3": "input",
  151073. "O": "output"
  151074. },
  151075. "connections": {
  151076. "I0": [ "0" ],
  151077. "I1": [ 6258 ],
  151078. "I2": [ 6259 ],
  151079. "I3": [ 6260 ],
  151080. "O": [ 6261 ]
  151081. }
  151082. },
  151083. "uart_I.uart_tx_I.ack_SB_LUT4_I1_O_SB_DFFR_D": {
  151084. "hide_name": 0,
  151085. "type": "SB_DFFR",
  151086. "parameters": {
  151087. },
  151088. "attributes": {
  151089. "module_not_derived": "00000000000000000000000000000001",
  151090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:116.2-120.27|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  151091. },
  151092. "port_directions": {
  151093. "C": "input",
  151094. "D": "input",
  151095. "Q": "output",
  151096. "R": "input"
  151097. },
  151098. "connections": {
  151099. "C": [ 42 ],
  151100. "D": [ 6261 ],
  151101. "Q": [ 6259 ],
  151102. "R": [ 127 ]
  151103. }
  151104. },
  151105. "uart_I.uart_tx_I.bit_cnt_SB_DFFESR_Q": {
  151106. "hide_name": 0,
  151107. "type": "SB_DFFESR",
  151108. "parameters": {
  151109. },
  151110. "attributes": {
  151111. "module_not_derived": "00000000000000000000000000000001",
  151112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:51.2-55.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  151113. },
  151114. "port_directions": {
  151115. "C": "input",
  151116. "D": "input",
  151117. "E": "input",
  151118. "Q": "output",
  151119. "R": "input"
  151120. },
  151121. "connections": {
  151122. "C": [ 42 ],
  151123. "D": [ 6262 ],
  151124. "E": [ 6263 ],
  151125. "Q": [ 6264 ],
  151126. "R": [ 6265 ]
  151127. }
  151128. },
  151129. "uart_I.uart_tx_I.bit_cnt_SB_DFFESR_Q_1": {
  151130. "hide_name": 0,
  151131. "type": "SB_DFFESR",
  151132. "parameters": {
  151133. },
  151134. "attributes": {
  151135. "module_not_derived": "00000000000000000000000000000001",
  151136. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:51.2-55.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  151137. },
  151138. "port_directions": {
  151139. "C": "input",
  151140. "D": "input",
  151141. "E": "input",
  151142. "Q": "output",
  151143. "R": "input"
  151144. },
  151145. "connections": {
  151146. "C": [ 42 ],
  151147. "D": [ 6266 ],
  151148. "E": [ 6263 ],
  151149. "Q": [ 6267 ],
  151150. "R": [ 6265 ]
  151151. }
  151152. },
  151153. "uart_I.uart_tx_I.bit_cnt_SB_DFFESR_Q_2": {
  151154. "hide_name": 0,
  151155. "type": "SB_DFFESR",
  151156. "parameters": {
  151157. },
  151158. "attributes": {
  151159. "module_not_derived": "00000000000000000000000000000001",
  151160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:51.2-55.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  151161. },
  151162. "port_directions": {
  151163. "C": "input",
  151164. "D": "input",
  151165. "E": "input",
  151166. "Q": "output",
  151167. "R": "input"
  151168. },
  151169. "connections": {
  151170. "C": [ 42 ],
  151171. "D": [ 6268 ],
  151172. "E": [ 6263 ],
  151173. "Q": [ 6269 ],
  151174. "R": [ 6265 ]
  151175. }
  151176. },
  151177. "uart_I.uart_tx_I.bit_cnt_SB_DFFESR_Q_3": {
  151178. "hide_name": 0,
  151179. "type": "SB_DFFESR",
  151180. "parameters": {
  151181. },
  151182. "attributes": {
  151183. "module_not_derived": "00000000000000000000000000000001",
  151184. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:51.2-55.27|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  151185. },
  151186. "port_directions": {
  151187. "C": "input",
  151188. "D": "input",
  151189. "E": "input",
  151190. "Q": "output",
  151191. "R": "input"
  151192. },
  151193. "connections": {
  151194. "C": [ 42 ],
  151195. "D": [ 6270 ],
  151196. "E": [ 6263 ],
  151197. "Q": [ 6271 ],
  151198. "R": [ 6265 ]
  151199. }
  151200. },
  151201. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q": {
  151202. "hide_name": 0,
  151203. "type": "SB_DFFESS",
  151204. "parameters": {
  151205. },
  151206. "attributes": {
  151207. "module_not_derived": "00000000000000000000000000000001",
  151208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:51.2-55.27|/usr/bin/../share/yosys/ice40/ff_map.v:25.66-25.119"
  151209. },
  151210. "port_directions": {
  151211. "C": "input",
  151212. "D": "input",
  151213. "E": "input",
  151214. "Q": "output",
  151215. "S": "input"
  151216. },
  151217. "connections": {
  151218. "C": [ 42 ],
  151219. "D": [ 6272 ],
  151220. "E": [ 6263 ],
  151221. "Q": [ 6273 ],
  151222. "S": [ 6265 ]
  151223. }
  151224. },
  151225. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O": {
  151226. "hide_name": 0,
  151227. "type": "SB_LUT4",
  151228. "parameters": {
  151229. "LUT_INIT": "0110100110010110"
  151230. },
  151231. "attributes": {
  151232. "module_not_derived": "00000000000000000000000000000001",
  151233. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151234. },
  151235. "port_directions": {
  151236. "I0": "input",
  151237. "I1": "input",
  151238. "I2": "input",
  151239. "I3": "input",
  151240. "O": "output"
  151241. },
  151242. "connections": {
  151243. "I0": [ "0" ],
  151244. "I1": [ 6269 ],
  151245. "I2": [ "1" ],
  151246. "I3": [ 6271 ],
  151247. "O": [ 6268 ]
  151248. }
  151249. },
  151250. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_1": {
  151251. "hide_name": 0,
  151252. "type": "SB_LUT4",
  151253. "parameters": {
  151254. "LUT_INIT": "0110100110010110"
  151255. },
  151256. "attributes": {
  151257. "module_not_derived": "00000000000000000000000000000001",
  151258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151259. },
  151260. "port_directions": {
  151261. "I0": "input",
  151262. "I1": "input",
  151263. "I2": "input",
  151264. "I3": "input",
  151265. "O": "output"
  151266. },
  151267. "connections": {
  151268. "I0": [ "0" ],
  151269. "I1": [ 6267 ],
  151270. "I2": [ "1" ],
  151271. "I3": [ 6274 ],
  151272. "O": [ 6266 ]
  151273. }
  151274. },
  151275. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  151276. "hide_name": 0,
  151277. "type": "SB_CARRY",
  151278. "parameters": {
  151279. },
  151280. "attributes": {
  151281. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151282. },
  151283. "port_directions": {
  151284. "CI": "input",
  151285. "CO": "output",
  151286. "I0": "input",
  151287. "I1": "input"
  151288. },
  151289. "connections": {
  151290. "CI": [ 6271 ],
  151291. "CO": [ 6274 ],
  151292. "I0": [ 6269 ],
  151293. "I1": [ "1" ]
  151294. }
  151295. },
  151296. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_2": {
  151297. "hide_name": 0,
  151298. "type": "SB_LUT4",
  151299. "parameters": {
  151300. "LUT_INIT": "0110100110010110"
  151301. },
  151302. "attributes": {
  151303. "module_not_derived": "00000000000000000000000000000001",
  151304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151305. },
  151306. "port_directions": {
  151307. "I0": "input",
  151308. "I1": "input",
  151309. "I2": "input",
  151310. "I3": "input",
  151311. "O": "output"
  151312. },
  151313. "connections": {
  151314. "I0": [ "0" ],
  151315. "I1": [ 6273 ],
  151316. "I2": [ "1" ],
  151317. "I3": [ 6275 ],
  151318. "O": [ 6272 ]
  151319. }
  151320. },
  151321. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  151322. "hide_name": 0,
  151323. "type": "SB_CARRY",
  151324. "parameters": {
  151325. },
  151326. "attributes": {
  151327. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151328. },
  151329. "port_directions": {
  151330. "CI": "input",
  151331. "CO": "output",
  151332. "I0": "input",
  151333. "I1": "input"
  151334. },
  151335. "connections": {
  151336. "CI": [ 6274 ],
  151337. "CO": [ 6275 ],
  151338. "I0": [ 6267 ],
  151339. "I1": [ "1" ]
  151340. }
  151341. },
  151342. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_3": {
  151343. "hide_name": 0,
  151344. "type": "SB_LUT4",
  151345. "parameters": {
  151346. "LUT_INIT": "0110100110010110"
  151347. },
  151348. "attributes": {
  151349. "module_not_derived": "00000000000000000000000000000001",
  151350. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151351. },
  151352. "port_directions": {
  151353. "I0": "input",
  151354. "I1": "input",
  151355. "I2": "input",
  151356. "I3": "input",
  151357. "O": "output"
  151358. },
  151359. "connections": {
  151360. "I0": [ "0" ],
  151361. "I1": [ 6264 ],
  151362. "I2": [ "1" ],
  151363. "I3": [ 6276 ],
  151364. "O": [ 6262 ]
  151365. }
  151366. },
  151367. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  151368. "hide_name": 0,
  151369. "type": "SB_CARRY",
  151370. "parameters": {
  151371. },
  151372. "attributes": {
  151373. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151374. },
  151375. "port_directions": {
  151376. "CI": "input",
  151377. "CO": "output",
  151378. "I0": "input",
  151379. "I1": "input"
  151380. },
  151381. "connections": {
  151382. "CI": [ 6275 ],
  151383. "CO": [ 6276 ],
  151384. "I0": [ 6273 ],
  151385. "I1": [ "1" ]
  151386. }
  151387. },
  151388. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_4": {
  151389. "hide_name": 0,
  151390. "type": "SB_LUT4",
  151391. "parameters": {
  151392. "LUT_INIT": "0000000011111111"
  151393. },
  151394. "attributes": {
  151395. "module_not_derived": "00000000000000000000000000000001",
  151396. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  151397. },
  151398. "port_directions": {
  151399. "I0": "input",
  151400. "I1": "input",
  151401. "I2": "input",
  151402. "I3": "input",
  151403. "O": "output"
  151404. },
  151405. "connections": {
  151406. "I0": [ "0" ],
  151407. "I1": [ "0" ],
  151408. "I2": [ "0" ],
  151409. "I3": [ 6271 ],
  151410. "O": [ 6270 ]
  151411. }
  151412. },
  151413. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_S_SB_LUT4_O": {
  151414. "hide_name": 0,
  151415. "type": "SB_LUT4",
  151416. "parameters": {
  151417. "LUT_INIT": "0000000011111111"
  151418. },
  151419. "attributes": {
  151420. "module_not_derived": "00000000000000000000000000000001",
  151421. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  151422. },
  151423. "port_directions": {
  151424. "I0": "input",
  151425. "I1": "input",
  151426. "I2": "input",
  151427. "I3": "input",
  151428. "O": "output"
  151429. },
  151430. "connections": {
  151431. "I0": [ "0" ],
  151432. "I1": [ "0" ],
  151433. "I2": [ "0" ],
  151434. "I3": [ 6277 ],
  151435. "O": [ 6265 ]
  151436. }
  151437. },
  151438. "uart_I.uart_tx_I.ce_SB_DFFSR_Q": {
  151439. "hide_name": 0,
  151440. "type": "SB_DFFSR",
  151441. "parameters": {
  151442. },
  151443. "attributes": {
  151444. "module_not_derived": "00000000000000000000000000000001",
  151445. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  151446. },
  151447. "port_directions": {
  151448. "C": "input",
  151449. "D": "input",
  151450. "Q": "output",
  151451. "R": "input"
  151452. },
  151453. "connections": {
  151454. "C": [ 42 ],
  151455. "D": [ 6278 ],
  151456. "Q": [ 6279 ],
  151457. "R": [ 6263 ]
  151458. }
  151459. },
  151460. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O": {
  151461. "hide_name": 0,
  151462. "type": "SB_LUT4",
  151463. "parameters": {
  151464. "LUT_INIT": "0110100110010110"
  151465. },
  151466. "attributes": {
  151467. "module_not_derived": "00000000000000000000000000000001",
  151468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151469. },
  151470. "port_directions": {
  151471. "I0": "input",
  151472. "I1": "input",
  151473. "I2": "input",
  151474. "I3": "input",
  151475. "O": "output"
  151476. },
  151477. "connections": {
  151478. "I0": [ "0" ],
  151479. "I1": [ 6279 ],
  151480. "I2": [ "1" ],
  151481. "I3": [ 6280 ],
  151482. "O": [ 6278 ]
  151483. }
  151484. },
  151485. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO": {
  151486. "hide_name": 0,
  151487. "type": "SB_CARRY",
  151488. "parameters": {
  151489. },
  151490. "attributes": {
  151491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151492. },
  151493. "port_directions": {
  151494. "CI": "input",
  151495. "CO": "output",
  151496. "I0": "input",
  151497. "I1": "input"
  151498. },
  151499. "connections": {
  151500. "CI": [ 6281 ],
  151501. "CO": [ 6280 ],
  151502. "I0": [ 6282 ],
  151503. "I1": [ "1" ]
  151504. }
  151505. },
  151506. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO": {
  151507. "hide_name": 0,
  151508. "type": "SB_CARRY",
  151509. "parameters": {
  151510. },
  151511. "attributes": {
  151512. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151513. },
  151514. "port_directions": {
  151515. "CI": "input",
  151516. "CO": "output",
  151517. "I0": "input",
  151518. "I1": "input"
  151519. },
  151520. "connections": {
  151521. "CI": [ 6283 ],
  151522. "CO": [ 6281 ],
  151523. "I0": [ 6284 ],
  151524. "I1": [ "1" ]
  151525. }
  151526. },
  151527. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  151528. "hide_name": 0,
  151529. "type": "SB_CARRY",
  151530. "parameters": {
  151531. },
  151532. "attributes": {
  151533. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151534. },
  151535. "port_directions": {
  151536. "CI": "input",
  151537. "CO": "output",
  151538. "I0": "input",
  151539. "I1": "input"
  151540. },
  151541. "connections": {
  151542. "CI": [ 6285 ],
  151543. "CO": [ 6283 ],
  151544. "I0": [ 6286 ],
  151545. "I1": [ "1" ]
  151546. }
  151547. },
  151548. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  151549. "hide_name": 0,
  151550. "type": "SB_CARRY",
  151551. "parameters": {
  151552. },
  151553. "attributes": {
  151554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151555. },
  151556. "port_directions": {
  151557. "CI": "input",
  151558. "CO": "output",
  151559. "I0": "input",
  151560. "I1": "input"
  151561. },
  151562. "connections": {
  151563. "CI": [ 6287 ],
  151564. "CO": [ 6285 ],
  151565. "I0": [ 6288 ],
  151566. "I1": [ "1" ]
  151567. }
  151568. },
  151569. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO": {
  151570. "hide_name": 0,
  151571. "type": "SB_CARRY",
  151572. "parameters": {
  151573. },
  151574. "attributes": {
  151575. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151576. },
  151577. "port_directions": {
  151578. "CI": "input",
  151579. "CO": "output",
  151580. "I0": "input",
  151581. "I1": "input"
  151582. },
  151583. "connections": {
  151584. "CI": [ 6289 ],
  151585. "CO": [ 6287 ],
  151586. "I0": [ 6290 ],
  151587. "I1": [ "1" ]
  151588. }
  151589. },
  151590. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_LUT4_I3": {
  151591. "hide_name": 0,
  151592. "type": "SB_LUT4",
  151593. "parameters": {
  151594. "LUT_INIT": "0110100110010110"
  151595. },
  151596. "attributes": {
  151597. "module_not_derived": "00000000000000000000000000000001",
  151598. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151599. },
  151600. "port_directions": {
  151601. "I0": "input",
  151602. "I1": "input",
  151603. "I2": "input",
  151604. "I3": "input",
  151605. "O": "output"
  151606. },
  151607. "connections": {
  151608. "I0": [ "0" ],
  151609. "I1": [ 6286 ],
  151610. "I2": [ "1" ],
  151611. "I3": [ 6285 ],
  151612. "O": [ 6291 ]
  151613. }
  151614. },
  151615. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_LUT4_I3": {
  151616. "hide_name": 0,
  151617. "type": "SB_LUT4",
  151618. "parameters": {
  151619. "LUT_INIT": "0110100110010110"
  151620. },
  151621. "attributes": {
  151622. "module_not_derived": "00000000000000000000000000000001",
  151623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151624. },
  151625. "port_directions": {
  151626. "I0": "input",
  151627. "I1": "input",
  151628. "I2": "input",
  151629. "I3": "input",
  151630. "O": "output"
  151631. },
  151632. "connections": {
  151633. "I0": [ "0" ],
  151634. "I1": [ 6284 ],
  151635. "I2": [ "1" ],
  151636. "I3": [ 6283 ],
  151637. "O": [ 6292 ]
  151638. }
  151639. },
  151640. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3": {
  151641. "hide_name": 0,
  151642. "type": "SB_LUT4",
  151643. "parameters": {
  151644. "LUT_INIT": "0110100110010110"
  151645. },
  151646. "attributes": {
  151647. "module_not_derived": "00000000000000000000000000000001",
  151648. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151649. },
  151650. "port_directions": {
  151651. "I0": "input",
  151652. "I1": "input",
  151653. "I2": "input",
  151654. "I3": "input",
  151655. "O": "output"
  151656. },
  151657. "connections": {
  151658. "I0": [ "0" ],
  151659. "I1": [ 6282 ],
  151660. "I2": [ "1" ],
  151661. "I3": [ 6281 ],
  151662. "O": [ 6293 ]
  151663. }
  151664. },
  151665. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3": {
  151666. "hide_name": 0,
  151667. "type": "SB_LUT4",
  151668. "parameters": {
  151669. "LUT_INIT": "1100111111000000"
  151670. },
  151671. "attributes": {
  151672. "module_not_derived": "00000000000000000000000000000001",
  151673. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151674. },
  151675. "port_directions": {
  151676. "I0": "input",
  151677. "I1": "input",
  151678. "I2": "input",
  151679. "I3": "input",
  151680. "O": "output"
  151681. },
  151682. "connections": {
  151683. "I0": [ "0" ],
  151684. "I1": [ 6011 ],
  151685. "I2": [ 6263 ],
  151686. "I3": [ 6293 ],
  151687. "O": [ 6294 ]
  151688. }
  151689. },
  151690. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O": {
  151691. "hide_name": 0,
  151692. "type": "SB_LUT4",
  151693. "parameters": {
  151694. "LUT_INIT": "1100110000001111"
  151695. },
  151696. "attributes": {
  151697. "module_not_derived": "00000000000000000000000000000001",
  151698. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151699. },
  151700. "port_directions": {
  151701. "I0": "input",
  151702. "I1": "input",
  151703. "I2": "input",
  151704. "I3": "input",
  151705. "O": "output"
  151706. },
  151707. "connections": {
  151708. "I0": [ "0" ],
  151709. "I1": [ 6014 ],
  151710. "I2": [ 6295 ],
  151711. "I3": [ 6263 ],
  151712. "O": [ 6296 ]
  151713. }
  151714. },
  151715. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1": {
  151716. "hide_name": 0,
  151717. "type": "SB_LUT4",
  151718. "parameters": {
  151719. "LUT_INIT": "1100111111000000"
  151720. },
  151721. "attributes": {
  151722. "module_not_derived": "00000000000000000000000000000001",
  151723. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151724. },
  151725. "port_directions": {
  151726. "I0": "input",
  151727. "I1": "input",
  151728. "I2": "input",
  151729. "I3": "input",
  151730. "O": "output"
  151731. },
  151732. "connections": {
  151733. "I0": [ "0" ],
  151734. "I1": [ 6015 ],
  151735. "I2": [ 6263 ],
  151736. "I3": [ 6291 ],
  151737. "O": [ 6297 ]
  151738. }
  151739. },
  151740. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_10": {
  151741. "hide_name": 0,
  151742. "type": "SB_LUT4",
  151743. "parameters": {
  151744. "LUT_INIT": "1100111111000000"
  151745. },
  151746. "attributes": {
  151747. "module_not_derived": "00000000000000000000000000000001",
  151748. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151749. },
  151750. "port_directions": {
  151751. "I0": "input",
  151752. "I1": "input",
  151753. "I2": "input",
  151754. "I3": "input",
  151755. "O": "output"
  151756. },
  151757. "connections": {
  151758. "I0": [ "0" ],
  151759. "I1": [ 6012 ],
  151760. "I2": [ 6263 ],
  151761. "I3": [ 6292 ],
  151762. "O": [ 6298 ]
  151763. }
  151764. },
  151765. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2": {
  151766. "hide_name": 0,
  151767. "type": "SB_LUT4",
  151768. "parameters": {
  151769. "LUT_INIT": "1100111111000000"
  151770. },
  151771. "attributes": {
  151772. "module_not_derived": "00000000000000000000000000000001",
  151773. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151774. },
  151775. "port_directions": {
  151776. "I0": "input",
  151777. "I1": "input",
  151778. "I2": "input",
  151779. "I3": "input",
  151780. "O": "output"
  151781. },
  151782. "connections": {
  151783. "I0": [ "0" ],
  151784. "I1": [ 6016 ],
  151785. "I2": [ 6263 ],
  151786. "I3": [ 6299 ],
  151787. "O": [ 6300 ]
  151788. }
  151789. },
  151790. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2_I3_SB_LUT4_O": {
  151791. "hide_name": 0,
  151792. "type": "SB_LUT4",
  151793. "parameters": {
  151794. "LUT_INIT": "0110100110010110"
  151795. },
  151796. "attributes": {
  151797. "module_not_derived": "00000000000000000000000000000001",
  151798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151799. },
  151800. "port_directions": {
  151801. "I0": "input",
  151802. "I1": "input",
  151803. "I2": "input",
  151804. "I3": "input",
  151805. "O": "output"
  151806. },
  151807. "connections": {
  151808. "I0": [ "0" ],
  151809. "I1": [ 6288 ],
  151810. "I2": [ "1" ],
  151811. "I3": [ 6287 ],
  151812. "O": [ 6299 ]
  151813. }
  151814. },
  151815. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3": {
  151816. "hide_name": 0,
  151817. "type": "SB_LUT4",
  151818. "parameters": {
  151819. "LUT_INIT": "1100111111000000"
  151820. },
  151821. "attributes": {
  151822. "module_not_derived": "00000000000000000000000000000001",
  151823. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151824. },
  151825. "port_directions": {
  151826. "I0": "input",
  151827. "I1": "input",
  151828. "I2": "input",
  151829. "I3": "input",
  151830. "O": "output"
  151831. },
  151832. "connections": {
  151833. "I0": [ "0" ],
  151834. "I1": [ 6017 ],
  151835. "I2": [ 6263 ],
  151836. "I3": [ 6301 ],
  151837. "O": [ 6302 ]
  151838. }
  151839. },
  151840. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3_SB_LUT4_O": {
  151841. "hide_name": 0,
  151842. "type": "SB_LUT4",
  151843. "parameters": {
  151844. "LUT_INIT": "0110100110010110"
  151845. },
  151846. "attributes": {
  151847. "module_not_derived": "00000000000000000000000000000001",
  151848. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151849. },
  151850. "port_directions": {
  151851. "I0": "input",
  151852. "I1": "input",
  151853. "I2": "input",
  151854. "I3": "input",
  151855. "O": "output"
  151856. },
  151857. "connections": {
  151858. "I0": [ "0" ],
  151859. "I1": [ 6290 ],
  151860. "I2": [ "1" ],
  151861. "I3": [ 6289 ],
  151862. "O": [ 6301 ]
  151863. }
  151864. },
  151865. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  151866. "hide_name": 0,
  151867. "type": "SB_CARRY",
  151868. "parameters": {
  151869. },
  151870. "attributes": {
  151871. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151872. },
  151873. "port_directions": {
  151874. "CI": "input",
  151875. "CO": "output",
  151876. "I0": "input",
  151877. "I1": "input"
  151878. },
  151879. "connections": {
  151880. "CI": [ 6303 ],
  151881. "CO": [ 6289 ],
  151882. "I0": [ 6304 ],
  151883. "I1": [ "1" ]
  151884. }
  151885. },
  151886. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4": {
  151887. "hide_name": 0,
  151888. "type": "SB_LUT4",
  151889. "parameters": {
  151890. "LUT_INIT": "1100111111000000"
  151891. },
  151892. "attributes": {
  151893. "module_not_derived": "00000000000000000000000000000001",
  151894. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151895. },
  151896. "port_directions": {
  151897. "I0": "input",
  151898. "I1": "input",
  151899. "I2": "input",
  151900. "I3": "input",
  151901. "O": "output"
  151902. },
  151903. "connections": {
  151904. "I0": [ "0" ],
  151905. "I1": [ 6018 ],
  151906. "I2": [ 6263 ],
  151907. "I3": [ 6305 ],
  151908. "O": [ 6306 ]
  151909. }
  151910. },
  151911. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3_SB_LUT4_O": {
  151912. "hide_name": 0,
  151913. "type": "SB_LUT4",
  151914. "parameters": {
  151915. "LUT_INIT": "0110100110010110"
  151916. },
  151917. "attributes": {
  151918. "module_not_derived": "00000000000000000000000000000001",
  151919. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151920. },
  151921. "port_directions": {
  151922. "I0": "input",
  151923. "I1": "input",
  151924. "I2": "input",
  151925. "I3": "input",
  151926. "O": "output"
  151927. },
  151928. "connections": {
  151929. "I0": [ "0" ],
  151930. "I1": [ 6304 ],
  151931. "I2": [ "1" ],
  151932. "I3": [ 6303 ],
  151933. "O": [ 6305 ]
  151934. }
  151935. },
  151936. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  151937. "hide_name": 0,
  151938. "type": "SB_CARRY",
  151939. "parameters": {
  151940. },
  151941. "attributes": {
  151942. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  151943. },
  151944. "port_directions": {
  151945. "CI": "input",
  151946. "CO": "output",
  151947. "I0": "input",
  151948. "I1": "input"
  151949. },
  151950. "connections": {
  151951. "CI": [ 6307 ],
  151952. "CO": [ 6303 ],
  151953. "I0": [ 6308 ],
  151954. "I1": [ "1" ]
  151955. }
  151956. },
  151957. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5": {
  151958. "hide_name": 0,
  151959. "type": "SB_LUT4",
  151960. "parameters": {
  151961. "LUT_INIT": "1100111111000000"
  151962. },
  151963. "attributes": {
  151964. "module_not_derived": "00000000000000000000000000000001",
  151965. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  151966. },
  151967. "port_directions": {
  151968. "I0": "input",
  151969. "I1": "input",
  151970. "I2": "input",
  151971. "I3": "input",
  151972. "O": "output"
  151973. },
  151974. "connections": {
  151975. "I0": [ "0" ],
  151976. "I1": [ 6019 ],
  151977. "I2": [ 6263 ],
  151978. "I3": [ 6309 ],
  151979. "O": [ 6310 ]
  151980. }
  151981. },
  151982. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3_SB_LUT4_O": {
  151983. "hide_name": 0,
  151984. "type": "SB_LUT4",
  151985. "parameters": {
  151986. "LUT_INIT": "0110100110010110"
  151987. },
  151988. "attributes": {
  151989. "module_not_derived": "00000000000000000000000000000001",
  151990. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  151991. },
  151992. "port_directions": {
  151993. "I0": "input",
  151994. "I1": "input",
  151995. "I2": "input",
  151996. "I3": "input",
  151997. "O": "output"
  151998. },
  151999. "connections": {
  152000. "I0": [ "0" ],
  152001. "I1": [ 6308 ],
  152002. "I2": [ "1" ],
  152003. "I3": [ 6307 ],
  152004. "O": [ 6309 ]
  152005. }
  152006. },
  152007. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  152008. "hide_name": 0,
  152009. "type": "SB_CARRY",
  152010. "parameters": {
  152011. },
  152012. "attributes": {
  152013. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  152014. },
  152015. "port_directions": {
  152016. "CI": "input",
  152017. "CO": "output",
  152018. "I0": "input",
  152019. "I1": "input"
  152020. },
  152021. "connections": {
  152022. "CI": [ 6311 ],
  152023. "CO": [ 6307 ],
  152024. "I0": [ 6312 ],
  152025. "I1": [ "1" ]
  152026. }
  152027. },
  152028. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6": {
  152029. "hide_name": 0,
  152030. "type": "SB_LUT4",
  152031. "parameters": {
  152032. "LUT_INIT": "1100111111000000"
  152033. },
  152034. "attributes": {
  152035. "module_not_derived": "00000000000000000000000000000001",
  152036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152037. },
  152038. "port_directions": {
  152039. "I0": "input",
  152040. "I1": "input",
  152041. "I2": "input",
  152042. "I3": "input",
  152043. "O": "output"
  152044. },
  152045. "connections": {
  152046. "I0": [ "0" ],
  152047. "I1": [ 6020 ],
  152048. "I2": [ 6263 ],
  152049. "I3": [ 6313 ],
  152050. "O": [ 6314 ]
  152051. }
  152052. },
  152053. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3_SB_LUT4_O": {
  152054. "hide_name": 0,
  152055. "type": "SB_LUT4",
  152056. "parameters": {
  152057. "LUT_INIT": "0110100110010110"
  152058. },
  152059. "attributes": {
  152060. "module_not_derived": "00000000000000000000000000000001",
  152061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  152062. },
  152063. "port_directions": {
  152064. "I0": "input",
  152065. "I1": "input",
  152066. "I2": "input",
  152067. "I3": "input",
  152068. "O": "output"
  152069. },
  152070. "connections": {
  152071. "I0": [ "0" ],
  152072. "I1": [ 6312 ],
  152073. "I2": [ "1" ],
  152074. "I3": [ 6311 ],
  152075. "O": [ 6313 ]
  152076. }
  152077. },
  152078. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  152079. "hide_name": 0,
  152080. "type": "SB_CARRY",
  152081. "parameters": {
  152082. },
  152083. "attributes": {
  152084. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  152085. },
  152086. "port_directions": {
  152087. "CI": "input",
  152088. "CO": "output",
  152089. "I0": "input",
  152090. "I1": "input"
  152091. },
  152092. "connections": {
  152093. "CI": [ 6315 ],
  152094. "CO": [ 6311 ],
  152095. "I0": [ 6316 ],
  152096. "I1": [ "1" ]
  152097. }
  152098. },
  152099. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7": {
  152100. "hide_name": 0,
  152101. "type": "SB_LUT4",
  152102. "parameters": {
  152103. "LUT_INIT": "1100111111000000"
  152104. },
  152105. "attributes": {
  152106. "module_not_derived": "00000000000000000000000000000001",
  152107. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152108. },
  152109. "port_directions": {
  152110. "I0": "input",
  152111. "I1": "input",
  152112. "I2": "input",
  152113. "I3": "input",
  152114. "O": "output"
  152115. },
  152116. "connections": {
  152117. "I0": [ "0" ],
  152118. "I1": [ 6021 ],
  152119. "I2": [ 6263 ],
  152120. "I3": [ 6317 ],
  152121. "O": [ 6318 ]
  152122. }
  152123. },
  152124. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3_SB_LUT4_O": {
  152125. "hide_name": 0,
  152126. "type": "SB_LUT4",
  152127. "parameters": {
  152128. "LUT_INIT": "0110100110010110"
  152129. },
  152130. "attributes": {
  152131. "module_not_derived": "00000000000000000000000000000001",
  152132. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  152133. },
  152134. "port_directions": {
  152135. "I0": "input",
  152136. "I1": "input",
  152137. "I2": "input",
  152138. "I3": "input",
  152139. "O": "output"
  152140. },
  152141. "connections": {
  152142. "I0": [ "0" ],
  152143. "I1": [ 6316 ],
  152144. "I2": [ "1" ],
  152145. "I3": [ 6315 ],
  152146. "O": [ 6317 ]
  152147. }
  152148. },
  152149. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  152150. "hide_name": 0,
  152151. "type": "SB_CARRY",
  152152. "parameters": {
  152153. },
  152154. "attributes": {
  152155. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  152156. },
  152157. "port_directions": {
  152158. "CI": "input",
  152159. "CO": "output",
  152160. "I0": "input",
  152161. "I1": "input"
  152162. },
  152163. "connections": {
  152164. "CI": [ 6319 ],
  152165. "CO": [ 6315 ],
  152166. "I0": [ 6320 ],
  152167. "I1": [ "1" ]
  152168. }
  152169. },
  152170. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8": {
  152171. "hide_name": 0,
  152172. "type": "SB_LUT4",
  152173. "parameters": {
  152174. "LUT_INIT": "1100110011110000"
  152175. },
  152176. "attributes": {
  152177. "module_not_derived": "00000000000000000000000000000001",
  152178. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152179. },
  152180. "port_directions": {
  152181. "I0": "input",
  152182. "I1": "input",
  152183. "I2": "input",
  152184. "I3": "input",
  152185. "O": "output"
  152186. },
  152187. "connections": {
  152188. "I0": [ "0" ],
  152189. "I1": [ 6022 ],
  152190. "I2": [ 6321 ],
  152191. "I3": [ 6263 ],
  152192. "O": [ 6322 ]
  152193. }
  152194. },
  152195. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O": {
  152196. "hide_name": 0,
  152197. "type": "SB_LUT4",
  152198. "parameters": {
  152199. "LUT_INIT": "0110100110010110"
  152200. },
  152201. "attributes": {
  152202. "module_not_derived": "00000000000000000000000000000001",
  152203. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  152204. },
  152205. "port_directions": {
  152206. "I0": "input",
  152207. "I1": "input",
  152208. "I2": "input",
  152209. "I3": "input",
  152210. "O": "output"
  152211. },
  152212. "connections": {
  152213. "I0": [ "0" ],
  152214. "I1": [ 6320 ],
  152215. "I2": [ "1" ],
  152216. "I3": [ 6319 ],
  152217. "O": [ 6321 ]
  152218. }
  152219. },
  152220. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_CARRY_CO": {
  152221. "hide_name": 0,
  152222. "type": "SB_CARRY",
  152223. "parameters": {
  152224. },
  152225. "attributes": {
  152226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  152227. },
  152228. "port_directions": {
  152229. "CI": "input",
  152230. "CO": "output",
  152231. "I0": "input",
  152232. "I1": "input"
  152233. },
  152234. "connections": {
  152235. "CI": [ 6295 ],
  152236. "CO": [ 6319 ],
  152237. "I0": [ 6323 ],
  152238. "I1": [ "1" ]
  152239. }
  152240. },
  152241. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_9": {
  152242. "hide_name": 0,
  152243. "type": "SB_LUT4",
  152244. "parameters": {
  152245. "LUT_INIT": "1100110011110000"
  152246. },
  152247. "attributes": {
  152248. "module_not_derived": "00000000000000000000000000000001",
  152249. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152250. },
  152251. "port_directions": {
  152252. "I0": "input",
  152253. "I1": "input",
  152254. "I2": "input",
  152255. "I3": "input",
  152256. "O": "output"
  152257. },
  152258. "connections": {
  152259. "I0": [ "0" ],
  152260. "I1": [ 6013 ],
  152261. "I2": [ 6324 ],
  152262. "I3": [ 6263 ],
  152263. "O": [ 6325 ]
  152264. }
  152265. },
  152266. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_9_I2_SB_LUT4_O": {
  152267. "hide_name": 0,
  152268. "type": "SB_LUT4",
  152269. "parameters": {
  152270. "LUT_INIT": "0110100110010110"
  152271. },
  152272. "attributes": {
  152273. "module_not_derived": "00000000000000000000000000000001",
  152274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  152275. },
  152276. "port_directions": {
  152277. "I0": "input",
  152278. "I1": "input",
  152279. "I2": "input",
  152280. "I3": "input",
  152281. "O": "output"
  152282. },
  152283. "connections": {
  152284. "I0": [ "0" ],
  152285. "I1": [ 6323 ],
  152286. "I2": [ "1" ],
  152287. "I3": [ 6295 ],
  152288. "O": [ 6324 ]
  152289. }
  152290. },
  152291. "uart_I.uart_tx_I.ce_SB_LUT4_I0": {
  152292. "hide_name": 0,
  152293. "type": "SB_LUT4",
  152294. "parameters": {
  152295. "LUT_INIT": "0111011111110000"
  152296. },
  152297. "attributes": {
  152298. "module_not_derived": "00000000000000000000000000000001",
  152299. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  152300. },
  152301. "port_directions": {
  152302. "I0": "input",
  152303. "I1": "input",
  152304. "I2": "input",
  152305. "I3": "input",
  152306. "O": "output"
  152307. },
  152308. "connections": {
  152309. "I0": [ 6279 ],
  152310. "I1": [ 6264 ],
  152311. "I2": [ 6259 ],
  152312. "I3": [ 6277 ],
  152313. "O": [ 6326 ]
  152314. }
  152315. },
  152316. "uart_I.uart_tx_I.ce_SB_LUT4_I0_O_SB_DFFR_D": {
  152317. "hide_name": 0,
  152318. "type": "SB_DFFR",
  152319. "parameters": {
  152320. },
  152321. "attributes": {
  152322. "module_not_derived": "00000000000000000000000000000001",
  152323. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:35.2-39.36|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  152324. },
  152325. "port_directions": {
  152326. "C": "input",
  152327. "D": "input",
  152328. "Q": "output",
  152329. "R": "input"
  152330. },
  152331. "connections": {
  152332. "C": [ 42 ],
  152333. "D": [ 6326 ],
  152334. "Q": [ 6277 ],
  152335. "R": [ 127 ]
  152336. }
  152337. },
  152338. "uart_I.uart_tx_I.ce_SB_LUT4_I2": {
  152339. "hide_name": 0,
  152340. "type": "SB_LUT4",
  152341. "parameters": {
  152342. "LUT_INIT": "1111000011111111"
  152343. },
  152344. "attributes": {
  152345. "module_not_derived": "00000000000000000000000000000001",
  152346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  152347. },
  152348. "port_directions": {
  152349. "I0": "input",
  152350. "I1": "input",
  152351. "I2": "input",
  152352. "I3": "input",
  152353. "O": "output"
  152354. },
  152355. "connections": {
  152356. "I0": [ "0" ],
  152357. "I1": [ "0" ],
  152358. "I2": [ 6279 ],
  152359. "I3": [ 6277 ],
  152360. "O": [ 6263 ]
  152361. }
  152362. },
  152363. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1": {
  152364. "hide_name": 0,
  152365. "type": "SB_LUT4",
  152366. "parameters": {
  152367. "LUT_INIT": "1111111111110000"
  152368. },
  152369. "attributes": {
  152370. "module_not_derived": "00000000000000000000000000000001",
  152371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  152372. },
  152373. "port_directions": {
  152374. "I0": "input",
  152375. "I1": "input",
  152376. "I2": "input",
  152377. "I3": "input",
  152378. "O": "output"
  152379. },
  152380. "connections": {
  152381. "I0": [ "0" ],
  152382. "I1": [ "0" ],
  152383. "I2": [ 6279 ],
  152384. "I3": [ 6257 ],
  152385. "O": [ 6327 ]
  152386. }
  152387. },
  152388. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E": {
  152389. "hide_name": 0,
  152390. "type": "SB_DFFES",
  152391. "parameters": {
  152392. },
  152393. "attributes": {
  152394. "module_not_derived": "00000000000000000000000000000001",
  152395. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152396. },
  152397. "port_directions": {
  152398. "C": "input",
  152399. "D": "input",
  152400. "E": "input",
  152401. "Q": "output",
  152402. "S": "input"
  152403. },
  152404. "connections": {
  152405. "C": [ 42 ],
  152406. "D": [ 6328 ],
  152407. "E": [ 6327 ],
  152408. "Q": [ 6329 ],
  152409. "S": [ 127 ]
  152410. }
  152411. },
  152412. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_1": {
  152413. "hide_name": 0,
  152414. "type": "SB_DFFES",
  152415. "parameters": {
  152416. },
  152417. "attributes": {
  152418. "module_not_derived": "00000000000000000000000000000001",
  152419. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152420. },
  152421. "port_directions": {
  152422. "C": "input",
  152423. "D": "input",
  152424. "E": "input",
  152425. "Q": "output",
  152426. "S": "input"
  152427. },
  152428. "connections": {
  152429. "C": [ 42 ],
  152430. "D": [ 6330 ],
  152431. "E": [ 6327 ],
  152432. "Q": [ 6331 ],
  152433. "S": [ 127 ]
  152434. }
  152435. },
  152436. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_2": {
  152437. "hide_name": 0,
  152438. "type": "SB_DFFES",
  152439. "parameters": {
  152440. },
  152441. "attributes": {
  152442. "module_not_derived": "00000000000000000000000000000001",
  152443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152444. },
  152445. "port_directions": {
  152446. "C": "input",
  152447. "D": "input",
  152448. "E": "input",
  152449. "Q": "output",
  152450. "S": "input"
  152451. },
  152452. "connections": {
  152453. "C": [ 42 ],
  152454. "D": [ 6332 ],
  152455. "E": [ 6327 ],
  152456. "Q": [ 6333 ],
  152457. "S": [ 127 ]
  152458. }
  152459. },
  152460. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_3": {
  152461. "hide_name": 0,
  152462. "type": "SB_DFFES",
  152463. "parameters": {
  152464. },
  152465. "attributes": {
  152466. "module_not_derived": "00000000000000000000000000000001",
  152467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152468. },
  152469. "port_directions": {
  152470. "C": "input",
  152471. "D": "input",
  152472. "E": "input",
  152473. "Q": "output",
  152474. "S": "input"
  152475. },
  152476. "connections": {
  152477. "C": [ 42 ],
  152478. "D": [ 6334 ],
  152479. "E": [ 6327 ],
  152480. "Q": [ 6335 ],
  152481. "S": [ 127 ]
  152482. }
  152483. },
  152484. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_4": {
  152485. "hide_name": 0,
  152486. "type": "SB_DFFES",
  152487. "parameters": {
  152488. },
  152489. "attributes": {
  152490. "module_not_derived": "00000000000000000000000000000001",
  152491. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152492. },
  152493. "port_directions": {
  152494. "C": "input",
  152495. "D": "input",
  152496. "E": "input",
  152497. "Q": "output",
  152498. "S": "input"
  152499. },
  152500. "connections": {
  152501. "C": [ 42 ],
  152502. "D": [ 6336 ],
  152503. "E": [ 6327 ],
  152504. "Q": [ 6337 ],
  152505. "S": [ 127 ]
  152506. }
  152507. },
  152508. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_5": {
  152509. "hide_name": 0,
  152510. "type": "SB_DFFES",
  152511. "parameters": {
  152512. },
  152513. "attributes": {
  152514. "module_not_derived": "00000000000000000000000000000001",
  152515. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152516. },
  152517. "port_directions": {
  152518. "C": "input",
  152519. "D": "input",
  152520. "E": "input",
  152521. "Q": "output",
  152522. "S": "input"
  152523. },
  152524. "connections": {
  152525. "C": [ 42 ],
  152526. "D": [ 6338 ],
  152527. "E": [ 6327 ],
  152528. "Q": [ 6339 ],
  152529. "S": [ 127 ]
  152530. }
  152531. },
  152532. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_6": {
  152533. "hide_name": 0,
  152534. "type": "SB_DFFES",
  152535. "parameters": {
  152536. },
  152537. "attributes": {
  152538. "module_not_derived": "00000000000000000000000000000001",
  152539. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152540. },
  152541. "port_directions": {
  152542. "C": "input",
  152543. "D": "input",
  152544. "E": "input",
  152545. "Q": "output",
  152546. "S": "input"
  152547. },
  152548. "connections": {
  152549. "C": [ 42 ],
  152550. "D": [ 6340 ],
  152551. "E": [ 6327 ],
  152552. "Q": [ 6341 ],
  152553. "S": [ 127 ]
  152554. }
  152555. },
  152556. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_7": {
  152557. "hide_name": 0,
  152558. "type": "SB_DFFES",
  152559. "parameters": {
  152560. },
  152561. "attributes": {
  152562. "module_not_derived": "00000000000000000000000000000001",
  152563. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  152564. },
  152565. "port_directions": {
  152566. "C": "input",
  152567. "D": "input",
  152568. "E": "input",
  152569. "Q": "output",
  152570. "S": "input"
  152571. },
  152572. "connections": {
  152573. "C": [ 42 ],
  152574. "D": [ 6342 ],
  152575. "E": [ 6327 ],
  152576. "Q": [ 6343 ],
  152577. "S": [ 127 ]
  152578. }
  152579. },
  152580. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q": {
  152581. "hide_name": 0,
  152582. "type": "SB_DFF",
  152583. "parameters": {
  152584. },
  152585. "attributes": {
  152586. "module_not_derived": "00000000000000000000000000000001",
  152587. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152588. },
  152589. "port_directions": {
  152590. "C": "input",
  152591. "D": "input",
  152592. "Q": "output"
  152593. },
  152594. "connections": {
  152595. "C": [ 42 ],
  152596. "D": [ 6294 ],
  152597. "Q": [ 6282 ]
  152598. }
  152599. },
  152600. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_1": {
  152601. "hide_name": 0,
  152602. "type": "SB_DFF",
  152603. "parameters": {
  152604. },
  152605. "attributes": {
  152606. "module_not_derived": "00000000000000000000000000000001",
  152607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152608. },
  152609. "port_directions": {
  152610. "C": "input",
  152611. "D": "input",
  152612. "Q": "output"
  152613. },
  152614. "connections": {
  152615. "C": [ 42 ],
  152616. "D": [ 6298 ],
  152617. "Q": [ 6284 ]
  152618. }
  152619. },
  152620. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_10": {
  152621. "hide_name": 0,
  152622. "type": "SB_DFF",
  152623. "parameters": {
  152624. },
  152625. "attributes": {
  152626. "module_not_derived": "00000000000000000000000000000001",
  152627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152628. },
  152629. "port_directions": {
  152630. "C": "input",
  152631. "D": "input",
  152632. "Q": "output"
  152633. },
  152634. "connections": {
  152635. "C": [ 42 ],
  152636. "D": [ 6325 ],
  152637. "Q": [ 6323 ]
  152638. }
  152639. },
  152640. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_11": {
  152641. "hide_name": 0,
  152642. "type": "SB_DFF",
  152643. "parameters": {
  152644. },
  152645. "attributes": {
  152646. "module_not_derived": "00000000000000000000000000000001",
  152647. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152648. },
  152649. "port_directions": {
  152650. "C": "input",
  152651. "D": "input",
  152652. "Q": "output"
  152653. },
  152654. "connections": {
  152655. "C": [ 42 ],
  152656. "D": [ 6296 ],
  152657. "Q": [ 6295 ]
  152658. }
  152659. },
  152660. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_2": {
  152661. "hide_name": 0,
  152662. "type": "SB_DFF",
  152663. "parameters": {
  152664. },
  152665. "attributes": {
  152666. "module_not_derived": "00000000000000000000000000000001",
  152667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152668. },
  152669. "port_directions": {
  152670. "C": "input",
  152671. "D": "input",
  152672. "Q": "output"
  152673. },
  152674. "connections": {
  152675. "C": [ 42 ],
  152676. "D": [ 6297 ],
  152677. "Q": [ 6286 ]
  152678. }
  152679. },
  152680. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_3": {
  152681. "hide_name": 0,
  152682. "type": "SB_DFF",
  152683. "parameters": {
  152684. },
  152685. "attributes": {
  152686. "module_not_derived": "00000000000000000000000000000001",
  152687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152688. },
  152689. "port_directions": {
  152690. "C": "input",
  152691. "D": "input",
  152692. "Q": "output"
  152693. },
  152694. "connections": {
  152695. "C": [ 42 ],
  152696. "D": [ 6300 ],
  152697. "Q": [ 6288 ]
  152698. }
  152699. },
  152700. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_4": {
  152701. "hide_name": 0,
  152702. "type": "SB_DFF",
  152703. "parameters": {
  152704. },
  152705. "attributes": {
  152706. "module_not_derived": "00000000000000000000000000000001",
  152707. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152708. },
  152709. "port_directions": {
  152710. "C": "input",
  152711. "D": "input",
  152712. "Q": "output"
  152713. },
  152714. "connections": {
  152715. "C": [ 42 ],
  152716. "D": [ 6302 ],
  152717. "Q": [ 6290 ]
  152718. }
  152719. },
  152720. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_5": {
  152721. "hide_name": 0,
  152722. "type": "SB_DFF",
  152723. "parameters": {
  152724. },
  152725. "attributes": {
  152726. "module_not_derived": "00000000000000000000000000000001",
  152727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152728. },
  152729. "port_directions": {
  152730. "C": "input",
  152731. "D": "input",
  152732. "Q": "output"
  152733. },
  152734. "connections": {
  152735. "C": [ 42 ],
  152736. "D": [ 6306 ],
  152737. "Q": [ 6304 ]
  152738. }
  152739. },
  152740. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_6": {
  152741. "hide_name": 0,
  152742. "type": "SB_DFF",
  152743. "parameters": {
  152744. },
  152745. "attributes": {
  152746. "module_not_derived": "00000000000000000000000000000001",
  152747. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152748. },
  152749. "port_directions": {
  152750. "C": "input",
  152751. "D": "input",
  152752. "Q": "output"
  152753. },
  152754. "connections": {
  152755. "C": [ 42 ],
  152756. "D": [ 6310 ],
  152757. "Q": [ 6308 ]
  152758. }
  152759. },
  152760. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_7": {
  152761. "hide_name": 0,
  152762. "type": "SB_DFF",
  152763. "parameters": {
  152764. },
  152765. "attributes": {
  152766. "module_not_derived": "00000000000000000000000000000001",
  152767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152768. },
  152769. "port_directions": {
  152770. "C": "input",
  152771. "D": "input",
  152772. "Q": "output"
  152773. },
  152774. "connections": {
  152775. "C": [ 42 ],
  152776. "D": [ 6314 ],
  152777. "Q": [ 6312 ]
  152778. }
  152779. },
  152780. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_8": {
  152781. "hide_name": 0,
  152782. "type": "SB_DFF",
  152783. "parameters": {
  152784. },
  152785. "attributes": {
  152786. "module_not_derived": "00000000000000000000000000000001",
  152787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152788. },
  152789. "port_directions": {
  152790. "C": "input",
  152791. "D": "input",
  152792. "Q": "output"
  152793. },
  152794. "connections": {
  152795. "C": [ 42 ],
  152796. "D": [ 6318 ],
  152797. "Q": [ 6316 ]
  152798. }
  152799. },
  152800. "uart_I.uart_tx_I.div_cnt_SB_DFF_Q_9": {
  152801. "hide_name": 0,
  152802. "type": "SB_DFF",
  152803. "parameters": {
  152804. },
  152805. "attributes": {
  152806. "module_not_derived": "00000000000000000000000000000001",
  152807. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:42.2-46.27|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  152808. },
  152809. "port_directions": {
  152810. "C": "input",
  152811. "D": "input",
  152812. "Q": "output"
  152813. },
  152814. "connections": {
  152815. "C": [ 42 ],
  152816. "D": [ 6322 ],
  152817. "Q": [ 6320 ]
  152818. }
  152819. },
  152820. "uart_I.uart_tx_I.go_SB_LUT4_I3": {
  152821. "hide_name": 0,
  152822. "type": "SB_LUT4",
  152823. "parameters": {
  152824. "LUT_INIT": "1100110011110000"
  152825. },
  152826. "attributes": {
  152827. "module_not_derived": "00000000000000000000000000000001",
  152828. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152829. },
  152830. "port_directions": {
  152831. "I0": "input",
  152832. "I1": "input",
  152833. "I2": "input",
  152834. "I3": "input",
  152835. "O": "output"
  152836. },
  152837. "connections": {
  152838. "I0": [ "0" ],
  152839. "I1": [ 6344 ],
  152840. "I2": [ 6341 ],
  152841. "I3": [ 6257 ],
  152842. "O": [ 6342 ]
  152843. }
  152844. },
  152845. "uart_I.uart_tx_I.go_SB_LUT4_I3_1": {
  152846. "hide_name": 0,
  152847. "type": "SB_LUT4",
  152848. "parameters": {
  152849. "LUT_INIT": "1100110011110000"
  152850. },
  152851. "attributes": {
  152852. "module_not_derived": "00000000000000000000000000000001",
  152853. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152854. },
  152855. "port_directions": {
  152856. "I0": "input",
  152857. "I1": "input",
  152858. "I2": "input",
  152859. "I3": "input",
  152860. "O": "output"
  152861. },
  152862. "connections": {
  152863. "I0": [ "0" ],
  152864. "I1": [ 6345 ],
  152865. "I2": [ 6339 ],
  152866. "I3": [ 6257 ],
  152867. "O": [ 6340 ]
  152868. }
  152869. },
  152870. "uart_I.uart_tx_I.go_SB_LUT4_I3_2": {
  152871. "hide_name": 0,
  152872. "type": "SB_LUT4",
  152873. "parameters": {
  152874. "LUT_INIT": "1100110011110000"
  152875. },
  152876. "attributes": {
  152877. "module_not_derived": "00000000000000000000000000000001",
  152878. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152879. },
  152880. "port_directions": {
  152881. "I0": "input",
  152882. "I1": "input",
  152883. "I2": "input",
  152884. "I3": "input",
  152885. "O": "output"
  152886. },
  152887. "connections": {
  152888. "I0": [ "0" ],
  152889. "I1": [ 6346 ],
  152890. "I2": [ 6337 ],
  152891. "I3": [ 6257 ],
  152892. "O": [ 6338 ]
  152893. }
  152894. },
  152895. "uart_I.uart_tx_I.go_SB_LUT4_I3_3": {
  152896. "hide_name": 0,
  152897. "type": "SB_LUT4",
  152898. "parameters": {
  152899. "LUT_INIT": "1100110011110000"
  152900. },
  152901. "attributes": {
  152902. "module_not_derived": "00000000000000000000000000000001",
  152903. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152904. },
  152905. "port_directions": {
  152906. "I0": "input",
  152907. "I1": "input",
  152908. "I2": "input",
  152909. "I3": "input",
  152910. "O": "output"
  152911. },
  152912. "connections": {
  152913. "I0": [ "0" ],
  152914. "I1": [ 6347 ],
  152915. "I2": [ 6335 ],
  152916. "I3": [ 6257 ],
  152917. "O": [ 6336 ]
  152918. }
  152919. },
  152920. "uart_I.uart_tx_I.go_SB_LUT4_I3_4": {
  152921. "hide_name": 0,
  152922. "type": "SB_LUT4",
  152923. "parameters": {
  152924. "LUT_INIT": "1100110011110000"
  152925. },
  152926. "attributes": {
  152927. "module_not_derived": "00000000000000000000000000000001",
  152928. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152929. },
  152930. "port_directions": {
  152931. "I0": "input",
  152932. "I1": "input",
  152933. "I2": "input",
  152934. "I3": "input",
  152935. "O": "output"
  152936. },
  152937. "connections": {
  152938. "I0": [ "0" ],
  152939. "I1": [ 6348 ],
  152940. "I2": [ 6333 ],
  152941. "I3": [ 6257 ],
  152942. "O": [ 6334 ]
  152943. }
  152944. },
  152945. "uart_I.uart_tx_I.go_SB_LUT4_I3_5": {
  152946. "hide_name": 0,
  152947. "type": "SB_LUT4",
  152948. "parameters": {
  152949. "LUT_INIT": "1100110011110000"
  152950. },
  152951. "attributes": {
  152952. "module_not_derived": "00000000000000000000000000000001",
  152953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152954. },
  152955. "port_directions": {
  152956. "I0": "input",
  152957. "I1": "input",
  152958. "I2": "input",
  152959. "I3": "input",
  152960. "O": "output"
  152961. },
  152962. "connections": {
  152963. "I0": [ "0" ],
  152964. "I1": [ 6349 ],
  152965. "I2": [ 6331 ],
  152966. "I3": [ 6257 ],
  152967. "O": [ 6332 ]
  152968. }
  152969. },
  152970. "uart_I.uart_tx_I.go_SB_LUT4_I3_6": {
  152971. "hide_name": 0,
  152972. "type": "SB_LUT4",
  152973. "parameters": {
  152974. "LUT_INIT": "1100110011110000"
  152975. },
  152976. "attributes": {
  152977. "module_not_derived": "00000000000000000000000000000001",
  152978. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  152979. },
  152980. "port_directions": {
  152981. "I0": "input",
  152982. "I1": "input",
  152983. "I2": "input",
  152984. "I3": "input",
  152985. "O": "output"
  152986. },
  152987. "connections": {
  152988. "I0": [ "0" ],
  152989. "I1": [ 6350 ],
  152990. "I2": [ 6329 ],
  152991. "I3": [ 6257 ],
  152992. "O": [ 6330 ]
  152993. }
  152994. },
  152995. "uart_I.uart_tx_I.go_SB_LUT4_I3_7": {
  152996. "hide_name": 0,
  152997. "type": "SB_LUT4",
  152998. "parameters": {
  152999. "LUT_INIT": "1111000011111111"
  153000. },
  153001. "attributes": {
  153002. "module_not_derived": "00000000000000000000000000000001",
  153003. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  153004. },
  153005. "port_directions": {
  153006. "I0": "input",
  153007. "I1": "input",
  153008. "I2": "input",
  153009. "I3": "input",
  153010. "O": "output"
  153011. },
  153012. "connections": {
  153013. "I0": [ "0" ],
  153014. "I1": [ "0" ],
  153015. "I2": [ 6351 ],
  153016. "I3": [ 6257 ],
  153017. "O": [ 6328 ]
  153018. }
  153019. },
  153020. "uart_I.uart_tx_I.go_SB_LUT4_I3_8": {
  153021. "hide_name": 0,
  153022. "type": "SB_LUT4",
  153023. "parameters": {
  153024. "LUT_INIT": "0000000011110000"
  153025. },
  153026. "attributes": {
  153027. "module_not_derived": "00000000000000000000000000000001",
  153028. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  153029. },
  153030. "port_directions": {
  153031. "I0": "input",
  153032. "I1": "input",
  153033. "I2": "input",
  153034. "I3": "input",
  153035. "O": "output"
  153036. },
  153037. "connections": {
  153038. "I0": [ "0" ],
  153039. "I1": [ "0" ],
  153040. "I2": [ 6343 ],
  153041. "I3": [ 6257 ],
  153042. "O": [ 6352 ]
  153043. }
  153044. },
  153045. "uart_I.uart_tx_I.go_SB_LUT4_O": {
  153046. "hide_name": 0,
  153047. "type": "SB_LUT4",
  153048. "parameters": {
  153049. "LUT_INIT": "0000000011110000"
  153050. },
  153051. "attributes": {
  153052. "module_not_derived": "00000000000000000000000000000001",
  153053. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  153054. },
  153055. "port_directions": {
  153056. "I0": "input",
  153057. "I1": "input",
  153058. "I2": "input",
  153059. "I3": "input",
  153060. "O": "output"
  153061. },
  153062. "connections": {
  153063. "I0": [ "0" ],
  153064. "I1": [ "0" ],
  153065. "I2": [ 6259 ],
  153066. "I3": [ 6277 ],
  153067. "O": [ 6257 ]
  153068. }
  153069. },
  153070. "uart_I.uart_tx_fifo_I.full_SB_DFFR_Q": {
  153071. "hide_name": 0,
  153072. "type": "SB_DFFR",
  153073. "parameters": {
  153074. },
  153075. "attributes": {
  153076. "module_not_derived": "00000000000000000000000000000001",
  153077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:83.2-87.73|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  153078. },
  153079. "port_directions": {
  153080. "C": "input",
  153081. "D": "input",
  153082. "Q": "output",
  153083. "R": "input"
  153084. },
  153085. "connections": {
  153086. "C": [ 42 ],
  153087. "D": [ 6353 ],
  153088. "Q": [ 6354 ],
  153089. "R": [ 127 ]
  153090. }
  153091. },
  153092. "uart_I.uart_tx_fifo_I.full_SB_DFFR_Q_D_SB_LUT4_O": {
  153093. "hide_name": 0,
  153094. "type": "SB_LUT4",
  153095. "parameters": {
  153096. "LUT_INIT": "0000000011110011"
  153097. },
  153098. "attributes": {
  153099. "module_not_derived": "00000000000000000000000000000001",
  153100. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  153101. },
  153102. "port_directions": {
  153103. "I0": "input",
  153104. "I1": "input",
  153105. "I2": "input",
  153106. "I3": "input",
  153107. "O": "output"
  153108. },
  153109. "connections": {
  153110. "I0": [ "0" ],
  153111. "I1": [ 6258 ],
  153112. "I2": [ 6355 ],
  153113. "I3": [ 6356 ],
  153114. "O": [ 6353 ]
  153115. }
  153116. },
  153117. "uart_I.uart_tx_fifo_I.full_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  153118. "hide_name": 0,
  153119. "type": "SB_LUT4",
  153120. "parameters": {
  153121. "LUT_INIT": "0001010101010101"
  153122. },
  153123. "attributes": {
  153124. "module_not_derived": "00000000000000000000000000000001",
  153125. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153126. },
  153127. "port_directions": {
  153128. "I0": "input",
  153129. "I1": "input",
  153130. "I2": "input",
  153131. "I3": "input",
  153132. "O": "output"
  153133. },
  153134. "connections": {
  153135. "I0": [ 6354 ],
  153136. "I1": [ 6357 ],
  153137. "I2": [ 6358 ],
  153138. "I3": [ 6359 ],
  153139. "O": [ 6356 ]
  153140. }
  153141. },
  153142. "uart_I.uart_tx_fifo_I.lvl_dec_SB_LUT4_O": {
  153143. "hide_name": 0,
  153144. "type": "SB_LUT4",
  153145. "parameters": {
  153146. "LUT_INIT": "0000111100000000"
  153147. },
  153148. "attributes": {
  153149. "module_not_derived": "00000000000000000000000000000001",
  153150. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  153151. },
  153152. "port_directions": {
  153153. "I0": "input",
  153154. "I1": "input",
  153155. "I2": "input",
  153156. "I3": "input",
  153157. "O": "output"
  153158. },
  153159. "connections": {
  153160. "I0": [ "0" ],
  153161. "I1": [ "0" ],
  153162. "I2": [ 6355 ],
  153163. "I3": [ 6360 ],
  153164. "O": [ 6361 ]
  153165. }
  153166. },
  153167. "uart_I.uart_tx_fifo_I.lvl_mov_SB_CARRY_I1": {
  153168. "hide_name": 0,
  153169. "type": "SB_CARRY",
  153170. "parameters": {
  153171. },
  153172. "attributes": {
  153173. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153174. },
  153175. "port_directions": {
  153176. "CI": "input",
  153177. "CO": "output",
  153178. "I0": "input",
  153179. "I1": "input"
  153180. },
  153181. "connections": {
  153182. "CI": [ "0" ],
  153183. "CO": [ 6362 ],
  153184. "I0": [ 6363 ],
  153185. "I1": [ 6364 ]
  153186. }
  153187. },
  153188. "uart_I.uart_tx_fifo_I.lvl_mov_SB_CARRY_I1_CO_SB_CARRY_CI": {
  153189. "hide_name": 0,
  153190. "type": "SB_CARRY",
  153191. "parameters": {
  153192. },
  153193. "attributes": {
  153194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153195. },
  153196. "port_directions": {
  153197. "CI": "input",
  153198. "CO": "output",
  153199. "I0": "input",
  153200. "I1": "input"
  153201. },
  153202. "connections": {
  153203. "CI": [ 6362 ],
  153204. "CO": [ 6365 ],
  153205. "I0": [ 6366 ],
  153206. "I1": [ 6361 ]
  153207. }
  153208. },
  153209. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2": {
  153210. "hide_name": 0,
  153211. "type": "SB_LUT4",
  153212. "parameters": {
  153213. "LUT_INIT": "0110100110010110"
  153214. },
  153215. "attributes": {
  153216. "module_not_derived": "00000000000000000000000000000001",
  153217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153218. },
  153219. "port_directions": {
  153220. "I0": "input",
  153221. "I1": "input",
  153222. "I2": "input",
  153223. "I3": "input",
  153224. "O": "output"
  153225. },
  153226. "connections": {
  153227. "I0": [ "0" ],
  153228. "I1": [ 6363 ],
  153229. "I2": [ 6364 ],
  153230. "I3": [ "0" ],
  153231. "O": [ 6367 ]
  153232. }
  153233. },
  153234. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_I1_SB_DFFS_Q": {
  153235. "hide_name": 0,
  153236. "type": "SB_DFFS",
  153237. "parameters": {
  153238. },
  153239. "attributes": {
  153240. "module_not_derived": "00000000000000000000000000000001",
  153241. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153242. },
  153243. "port_directions": {
  153244. "C": "input",
  153245. "D": "input",
  153246. "Q": "output",
  153247. "S": "input"
  153248. },
  153249. "connections": {
  153250. "C": [ 42 ],
  153251. "D": [ 6367 ],
  153252. "Q": [ 6363 ],
  153253. "S": [ 127 ]
  153254. }
  153255. },
  153256. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_I1_SB_LUT4_I2": {
  153257. "hide_name": 0,
  153258. "type": "SB_LUT4",
  153259. "parameters": {
  153260. "LUT_INIT": "0000000001000000"
  153261. },
  153262. "attributes": {
  153263. "module_not_derived": "00000000000000000000000000000001",
  153264. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153265. },
  153266. "port_directions": {
  153267. "I0": "input",
  153268. "I1": "input",
  153269. "I2": "input",
  153270. "I3": "input",
  153271. "O": "output"
  153272. },
  153273. "connections": {
  153274. "I0": [ 6258 ],
  153275. "I1": [ 6355 ],
  153276. "I2": [ 6363 ],
  153277. "I3": [ 6260 ],
  153278. "O": [ 6357 ]
  153279. }
  153280. },
  153281. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_I1_SB_LUT4_I2_O_SB_LUT4_O": {
  153282. "hide_name": 0,
  153283. "type": "SB_LUT4",
  153284. "parameters": {
  153285. "LUT_INIT": "0000000010000000"
  153286. },
  153287. "attributes": {
  153288. "module_not_derived": "00000000000000000000000000000001",
  153289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153290. },
  153291. "port_directions": {
  153292. "I0": "input",
  153293. "I1": "input",
  153294. "I2": "input",
  153295. "I3": "input",
  153296. "O": "output"
  153297. },
  153298. "connections": {
  153299. "I0": [ 6368 ],
  153300. "I1": [ 6369 ],
  153301. "I2": [ 6370 ],
  153302. "I3": [ 6366 ],
  153303. "O": [ 6358 ]
  153304. }
  153305. },
  153306. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_I1_SB_LUT4_I2_O_SB_LUT4_O_1": {
  153307. "hide_name": 0,
  153308. "type": "SB_LUT4",
  153309. "parameters": {
  153310. "LUT_INIT": "1000000000000000"
  153311. },
  153312. "attributes": {
  153313. "module_not_derived": "00000000000000000000000000000001",
  153314. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153315. },
  153316. "port_directions": {
  153317. "I0": "input",
  153318. "I1": "input",
  153319. "I2": "input",
  153320. "I3": "input",
  153321. "O": "output"
  153322. },
  153323. "connections": {
  153324. "I0": [ 6371 ],
  153325. "I1": [ 6372 ],
  153326. "I2": [ 6373 ],
  153327. "I3": [ 6374 ],
  153328. "O": [ 6359 ]
  153329. }
  153330. },
  153331. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O": {
  153332. "hide_name": 0,
  153333. "type": "SB_LUT4",
  153334. "parameters": {
  153335. "LUT_INIT": "0110100110010110"
  153336. },
  153337. "attributes": {
  153338. "module_not_derived": "00000000000000000000000000000001",
  153339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153340. },
  153341. "port_directions": {
  153342. "I0": "input",
  153343. "I1": "input",
  153344. "I2": "input",
  153345. "I3": "input",
  153346. "O": "output"
  153347. },
  153348. "connections": {
  153349. "I0": [ "0" ],
  153350. "I1": [ 6260 ],
  153351. "I2": [ 6361 ],
  153352. "I3": [ 6375 ],
  153353. "O": [ 6376 ]
  153354. }
  153355. },
  153356. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_1": {
  153357. "hide_name": 0,
  153358. "type": "SB_LUT4",
  153359. "parameters": {
  153360. "LUT_INIT": "0110100110010110"
  153361. },
  153362. "attributes": {
  153363. "module_not_derived": "00000000000000000000000000000001",
  153364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153365. },
  153366. "port_directions": {
  153367. "I0": "input",
  153368. "I1": "input",
  153369. "I2": "input",
  153370. "I3": "input",
  153371. "O": "output"
  153372. },
  153373. "connections": {
  153374. "I0": [ "0" ],
  153375. "I1": [ 6371 ],
  153376. "I2": [ 6361 ],
  153377. "I3": [ 6377 ],
  153378. "O": [ 6378 ]
  153379. }
  153380. },
  153381. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_1_I1_SB_DFFS_Q": {
  153382. "hide_name": 0,
  153383. "type": "SB_DFFS",
  153384. "parameters": {
  153385. },
  153386. "attributes": {
  153387. "module_not_derived": "00000000000000000000000000000001",
  153388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153389. },
  153390. "port_directions": {
  153391. "C": "input",
  153392. "D": "input",
  153393. "Q": "output",
  153394. "S": "input"
  153395. },
  153396. "connections": {
  153397. "C": [ 42 ],
  153398. "D": [ 6378 ],
  153399. "Q": [ 6371 ],
  153400. "S": [ 127 ]
  153401. }
  153402. },
  153403. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  153404. "hide_name": 0,
  153405. "type": "SB_CARRY",
  153406. "parameters": {
  153407. },
  153408. "attributes": {
  153409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153410. },
  153411. "port_directions": {
  153412. "CI": "input",
  153413. "CO": "output",
  153414. "I0": "input",
  153415. "I1": "input"
  153416. },
  153417. "connections": {
  153418. "CI": [ 6379 ],
  153419. "CO": [ 6377 ],
  153420. "I0": [ 6372 ],
  153421. "I1": [ 6361 ]
  153422. }
  153423. },
  153424. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_2": {
  153425. "hide_name": 0,
  153426. "type": "SB_LUT4",
  153427. "parameters": {
  153428. "LUT_INIT": "0110100110010110"
  153429. },
  153430. "attributes": {
  153431. "module_not_derived": "00000000000000000000000000000001",
  153432. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153433. },
  153434. "port_directions": {
  153435. "I0": "input",
  153436. "I1": "input",
  153437. "I2": "input",
  153438. "I3": "input",
  153439. "O": "output"
  153440. },
  153441. "connections": {
  153442. "I0": [ "0" ],
  153443. "I1": [ 6373 ],
  153444. "I2": [ 6361 ],
  153445. "I3": [ 6380 ],
  153446. "O": [ 6381 ]
  153447. }
  153448. },
  153449. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_2_I1_SB_DFFS_Q": {
  153450. "hide_name": 0,
  153451. "type": "SB_DFFS",
  153452. "parameters": {
  153453. },
  153454. "attributes": {
  153455. "module_not_derived": "00000000000000000000000000000001",
  153456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153457. },
  153458. "port_directions": {
  153459. "C": "input",
  153460. "D": "input",
  153461. "Q": "output",
  153462. "S": "input"
  153463. },
  153464. "connections": {
  153465. "C": [ 42 ],
  153466. "D": [ 6381 ],
  153467. "Q": [ 6373 ],
  153468. "S": [ 127 ]
  153469. }
  153470. },
  153471. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  153472. "hide_name": 0,
  153473. "type": "SB_CARRY",
  153474. "parameters": {
  153475. },
  153476. "attributes": {
  153477. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153478. },
  153479. "port_directions": {
  153480. "CI": "input",
  153481. "CO": "output",
  153482. "I0": "input",
  153483. "I1": "input"
  153484. },
  153485. "connections": {
  153486. "CI": [ 6382 ],
  153487. "CO": [ 6380 ],
  153488. "I0": [ 6374 ],
  153489. "I1": [ 6361 ]
  153490. }
  153491. },
  153492. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_3": {
  153493. "hide_name": 0,
  153494. "type": "SB_LUT4",
  153495. "parameters": {
  153496. "LUT_INIT": "0110100110010110"
  153497. },
  153498. "attributes": {
  153499. "module_not_derived": "00000000000000000000000000000001",
  153500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153501. },
  153502. "port_directions": {
  153503. "I0": "input",
  153504. "I1": "input",
  153505. "I2": "input",
  153506. "I3": "input",
  153507. "O": "output"
  153508. },
  153509. "connections": {
  153510. "I0": [ "0" ],
  153511. "I1": [ 6366 ],
  153512. "I2": [ 6361 ],
  153513. "I3": [ 6362 ],
  153514. "O": [ 6383 ]
  153515. }
  153516. },
  153517. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_3_I1_SB_DFFS_Q": {
  153518. "hide_name": 0,
  153519. "type": "SB_DFFS",
  153520. "parameters": {
  153521. },
  153522. "attributes": {
  153523. "module_not_derived": "00000000000000000000000000000001",
  153524. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153525. },
  153526. "port_directions": {
  153527. "C": "input",
  153528. "D": "input",
  153529. "Q": "output",
  153530. "S": "input"
  153531. },
  153532. "connections": {
  153533. "C": [ 42 ],
  153534. "D": [ 6383 ],
  153535. "Q": [ 6366 ],
  153536. "S": [ 127 ]
  153537. }
  153538. },
  153539. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_4": {
  153540. "hide_name": 0,
  153541. "type": "SB_LUT4",
  153542. "parameters": {
  153543. "LUT_INIT": "0110100110010110"
  153544. },
  153545. "attributes": {
  153546. "module_not_derived": "00000000000000000000000000000001",
  153547. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153548. },
  153549. "port_directions": {
  153550. "I0": "input",
  153551. "I1": "input",
  153552. "I2": "input",
  153553. "I3": "input",
  153554. "O": "output"
  153555. },
  153556. "connections": {
  153557. "I0": [ "0" ],
  153558. "I1": [ 6370 ],
  153559. "I2": [ 6361 ],
  153560. "I3": [ 6365 ],
  153561. "O": [ 6384 ]
  153562. }
  153563. },
  153564. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_4_I1_SB_DFFS_Q": {
  153565. "hide_name": 0,
  153566. "type": "SB_DFFS",
  153567. "parameters": {
  153568. },
  153569. "attributes": {
  153570. "module_not_derived": "00000000000000000000000000000001",
  153571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153572. },
  153573. "port_directions": {
  153574. "C": "input",
  153575. "D": "input",
  153576. "Q": "output",
  153577. "S": "input"
  153578. },
  153579. "connections": {
  153580. "C": [ 42 ],
  153581. "D": [ 6384 ],
  153582. "Q": [ 6370 ],
  153583. "S": [ 127 ]
  153584. }
  153585. },
  153586. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_5": {
  153587. "hide_name": 0,
  153588. "type": "SB_LUT4",
  153589. "parameters": {
  153590. "LUT_INIT": "0110100110010110"
  153591. },
  153592. "attributes": {
  153593. "module_not_derived": "00000000000000000000000000000001",
  153594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153595. },
  153596. "port_directions": {
  153597. "I0": "input",
  153598. "I1": "input",
  153599. "I2": "input",
  153600. "I3": "input",
  153601. "O": "output"
  153602. },
  153603. "connections": {
  153604. "I0": [ "0" ],
  153605. "I1": [ 6369 ],
  153606. "I2": [ 6361 ],
  153607. "I3": [ 6385 ],
  153608. "O": [ 6386 ]
  153609. }
  153610. },
  153611. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_5_I1_SB_DFFS_Q": {
  153612. "hide_name": 0,
  153613. "type": "SB_DFFS",
  153614. "parameters": {
  153615. },
  153616. "attributes": {
  153617. "module_not_derived": "00000000000000000000000000000001",
  153618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153619. },
  153620. "port_directions": {
  153621. "C": "input",
  153622. "D": "input",
  153623. "Q": "output",
  153624. "S": "input"
  153625. },
  153626. "connections": {
  153627. "C": [ 42 ],
  153628. "D": [ 6386 ],
  153629. "Q": [ 6369 ],
  153630. "S": [ 127 ]
  153631. }
  153632. },
  153633. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  153634. "hide_name": 0,
  153635. "type": "SB_CARRY",
  153636. "parameters": {
  153637. },
  153638. "attributes": {
  153639. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153640. },
  153641. "port_directions": {
  153642. "CI": "input",
  153643. "CO": "output",
  153644. "I0": "input",
  153645. "I1": "input"
  153646. },
  153647. "connections": {
  153648. "CI": [ 6365 ],
  153649. "CO": [ 6385 ],
  153650. "I0": [ 6370 ],
  153651. "I1": [ 6361 ]
  153652. }
  153653. },
  153654. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_6": {
  153655. "hide_name": 0,
  153656. "type": "SB_LUT4",
  153657. "parameters": {
  153658. "LUT_INIT": "0110100110010110"
  153659. },
  153660. "attributes": {
  153661. "module_not_derived": "00000000000000000000000000000001",
  153662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153663. },
  153664. "port_directions": {
  153665. "I0": "input",
  153666. "I1": "input",
  153667. "I2": "input",
  153668. "I3": "input",
  153669. "O": "output"
  153670. },
  153671. "connections": {
  153672. "I0": [ "0" ],
  153673. "I1": [ 6368 ],
  153674. "I2": [ 6361 ],
  153675. "I3": [ 6387 ],
  153676. "O": [ 6388 ]
  153677. }
  153678. },
  153679. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_6_I1_SB_DFFS_Q": {
  153680. "hide_name": 0,
  153681. "type": "SB_DFFS",
  153682. "parameters": {
  153683. },
  153684. "attributes": {
  153685. "module_not_derived": "00000000000000000000000000000001",
  153686. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153687. },
  153688. "port_directions": {
  153689. "C": "input",
  153690. "D": "input",
  153691. "Q": "output",
  153692. "S": "input"
  153693. },
  153694. "connections": {
  153695. "C": [ 42 ],
  153696. "D": [ 6388 ],
  153697. "Q": [ 6368 ],
  153698. "S": [ 127 ]
  153699. }
  153700. },
  153701. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  153702. "hide_name": 0,
  153703. "type": "SB_CARRY",
  153704. "parameters": {
  153705. },
  153706. "attributes": {
  153707. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153708. },
  153709. "port_directions": {
  153710. "CI": "input",
  153711. "CO": "output",
  153712. "I0": "input",
  153713. "I1": "input"
  153714. },
  153715. "connections": {
  153716. "CI": [ 6385 ],
  153717. "CO": [ 6387 ],
  153718. "I0": [ 6369 ],
  153719. "I1": [ 6361 ]
  153720. }
  153721. },
  153722. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_7": {
  153723. "hide_name": 0,
  153724. "type": "SB_LUT4",
  153725. "parameters": {
  153726. "LUT_INIT": "0110100110010110"
  153727. },
  153728. "attributes": {
  153729. "module_not_derived": "00000000000000000000000000000001",
  153730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153731. },
  153732. "port_directions": {
  153733. "I0": "input",
  153734. "I1": "input",
  153735. "I2": "input",
  153736. "I3": "input",
  153737. "O": "output"
  153738. },
  153739. "connections": {
  153740. "I0": [ "0" ],
  153741. "I1": [ 6374 ],
  153742. "I2": [ 6361 ],
  153743. "I3": [ 6382 ],
  153744. "O": [ 6389 ]
  153745. }
  153746. },
  153747. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_7_I1_SB_DFFS_Q": {
  153748. "hide_name": 0,
  153749. "type": "SB_DFFS",
  153750. "parameters": {
  153751. },
  153752. "attributes": {
  153753. "module_not_derived": "00000000000000000000000000000001",
  153754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153755. },
  153756. "port_directions": {
  153757. "C": "input",
  153758. "D": "input",
  153759. "Q": "output",
  153760. "S": "input"
  153761. },
  153762. "connections": {
  153763. "C": [ 42 ],
  153764. "D": [ 6389 ],
  153765. "Q": [ 6374 ],
  153766. "S": [ 127 ]
  153767. }
  153768. },
  153769. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  153770. "hide_name": 0,
  153771. "type": "SB_CARRY",
  153772. "parameters": {
  153773. },
  153774. "attributes": {
  153775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153776. },
  153777. "port_directions": {
  153778. "CI": "input",
  153779. "CO": "output",
  153780. "I0": "input",
  153781. "I1": "input"
  153782. },
  153783. "connections": {
  153784. "CI": [ 6387 ],
  153785. "CO": [ 6382 ],
  153786. "I0": [ 6368 ],
  153787. "I1": [ 6361 ]
  153788. }
  153789. },
  153790. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_8": {
  153791. "hide_name": 0,
  153792. "type": "SB_LUT4",
  153793. "parameters": {
  153794. "LUT_INIT": "0110100110010110"
  153795. },
  153796. "attributes": {
  153797. "module_not_derived": "00000000000000000000000000000001",
  153798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  153799. },
  153800. "port_directions": {
  153801. "I0": "input",
  153802. "I1": "input",
  153803. "I2": "input",
  153804. "I3": "input",
  153805. "O": "output"
  153806. },
  153807. "connections": {
  153808. "I0": [ "0" ],
  153809. "I1": [ 6372 ],
  153810. "I2": [ 6361 ],
  153811. "I3": [ 6379 ],
  153812. "O": [ 6390 ]
  153813. }
  153814. },
  153815. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_8_I1_SB_DFFS_Q": {
  153816. "hide_name": 0,
  153817. "type": "SB_DFFS",
  153818. "parameters": {
  153819. },
  153820. "attributes": {
  153821. "module_not_derived": "00000000000000000000000000000001",
  153822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  153823. },
  153824. "port_directions": {
  153825. "C": "input",
  153826. "D": "input",
  153827. "Q": "output",
  153828. "S": "input"
  153829. },
  153830. "connections": {
  153831. "C": [ 42 ],
  153832. "D": [ 6390 ],
  153833. "Q": [ 6372 ],
  153834. "S": [ 127 ]
  153835. }
  153836. },
  153837. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_8_I3_SB_CARRY_CO": {
  153838. "hide_name": 0,
  153839. "type": "SB_CARRY",
  153840. "parameters": {
  153841. },
  153842. "attributes": {
  153843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153844. },
  153845. "port_directions": {
  153846. "CI": "input",
  153847. "CO": "output",
  153848. "I0": "input",
  153849. "I1": "input"
  153850. },
  153851. "connections": {
  153852. "CI": [ 6380 ],
  153853. "CO": [ 6379 ],
  153854. "I0": [ 6373 ],
  153855. "I1": [ 6361 ]
  153856. }
  153857. },
  153858. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_CARRY_CO": {
  153859. "hide_name": 0,
  153860. "type": "SB_CARRY",
  153861. "parameters": {
  153862. },
  153863. "attributes": {
  153864. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153865. },
  153866. "port_directions": {
  153867. "CI": "input",
  153868. "CO": "output",
  153869. "I0": "input",
  153870. "I1": "input"
  153871. },
  153872. "connections": {
  153873. "CI": [ 6377 ],
  153874. "CO": [ 6375 ],
  153875. "I0": [ 6371 ],
  153876. "I1": [ 6361 ]
  153877. }
  153878. },
  153879. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_O": {
  153880. "hide_name": 0,
  153881. "type": "SB_LUT4",
  153882. "parameters": {
  153883. "LUT_INIT": "0000111111110000"
  153884. },
  153885. "attributes": {
  153886. "module_not_derived": "00000000000000000000000000000001",
  153887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  153888. },
  153889. "port_directions": {
  153890. "I0": "input",
  153891. "I1": "input",
  153892. "I2": "input",
  153893. "I3": "input",
  153894. "O": "output"
  153895. },
  153896. "connections": {
  153897. "I0": [ "0" ],
  153898. "I1": [ "0" ],
  153899. "I2": [ 6355 ],
  153900. "I3": [ 6360 ],
  153901. "O": [ 6364 ]
  153902. }
  153903. },
  153904. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0": {
  153905. "hide_name": 0,
  153906. "type": "SB_RAM40_4K",
  153907. "parameters": {
  153908. "INIT_0": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153909. "INIT_1": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153910. "INIT_2": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153911. "INIT_3": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153912. "INIT_4": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153913. "INIT_5": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153914. "INIT_6": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153915. "INIT_7": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153916. "INIT_8": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153917. "INIT_9": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153918. "INIT_A": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153919. "INIT_B": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153920. "INIT_C": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153921. "INIT_D": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153922. "INIT_E": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153923. "INIT_F": "xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx",
  153924. "READ_MODE": "01",
  153925. "WRITE_MODE": "01"
  153926. },
  153927. "attributes": {
  153928. "module_not_derived": "00000000000000000000000000000001",
  153929. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765"
  153930. },
  153931. "port_directions": {
  153932. "MASK": "input",
  153933. "RADDR": "input",
  153934. "RCLK": "input",
  153935. "RCLKE": "input",
  153936. "RDATA": "output",
  153937. "RE": "input",
  153938. "WADDR": "input",
  153939. "WCLK": "input",
  153940. "WCLKE": "input",
  153941. "WDATA": "input",
  153942. "WE": "input"
  153943. },
  153944. "connections": {
  153945. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  153946. "RADDR": [ 6391, 6392, 6393, 6394, 6395, 6396, 6397, 6398, 6399, "0", "0" ],
  153947. "RCLK": [ 42 ],
  153948. "RCLKE": [ 6360 ],
  153949. "RDATA": [ 6344, 6400, 6348, 6401, 6346, 6402, 6350, 6403, 6345, 6404, 6349, 6405, 6347, 6406, 6351, 6407 ],
  153950. "RE": [ "1" ],
  153951. "WADDR": [ 6408, 6409, 6410, 6411, 6412, 6413, 6414, 6415, 6416, "0", "0" ],
  153952. "WCLK": [ 42 ],
  153953. "WCLKE": [ 6355 ],
  153954. "WDATA": [ 60, "0", 62, "0", 64, "0", 66, "0", 68, "0", 70, "0", 72, "0", 74, "0" ],
  153955. "WE": [ "1" ]
  153956. }
  153957. },
  153958. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_1_SB_CARRY_I1": {
  153959. "hide_name": 0,
  153960. "type": "SB_CARRY",
  153961. "parameters": {
  153962. },
  153963. "attributes": {
  153964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  153965. },
  153966. "port_directions": {
  153967. "CI": "input",
  153968. "CO": "output",
  153969. "I0": "input",
  153970. "I1": "input"
  153971. },
  153972. "connections": {
  153973. "CI": [ 6417 ],
  153974. "CO": [ 6418 ],
  153975. "I0": [ "0" ],
  153976. "I1": [ 6397 ]
  153977. }
  153978. },
  153979. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_1_SB_DFFER_Q": {
  153980. "hide_name": 0,
  153981. "type": "SB_DFFER",
  153982. "parameters": {
  153983. },
  153984. "attributes": {
  153985. "module_not_derived": "00000000000000000000000000000001",
  153986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  153987. },
  153988. "port_directions": {
  153989. "C": "input",
  153990. "D": "input",
  153991. "E": "input",
  153992. "Q": "output",
  153993. "R": "input"
  153994. },
  153995. "connections": {
  153996. "C": [ 42 ],
  153997. "D": [ 6419 ],
  153998. "E": [ 6360 ],
  153999. "Q": [ 6397 ],
  154000. "R": [ 127 ]
  154001. }
  154002. },
  154003. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_2_SB_CARRY_I1": {
  154004. "hide_name": 0,
  154005. "type": "SB_CARRY",
  154006. "parameters": {
  154007. },
  154008. "attributes": {
  154009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154010. },
  154011. "port_directions": {
  154012. "CI": "input",
  154013. "CO": "output",
  154014. "I0": "input",
  154015. "I1": "input"
  154016. },
  154017. "connections": {
  154018. "CI": [ 6420 ],
  154019. "CO": [ 6417 ],
  154020. "I0": [ "0" ],
  154021. "I1": [ 6396 ]
  154022. }
  154023. },
  154024. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_2_SB_DFFER_Q": {
  154025. "hide_name": 0,
  154026. "type": "SB_DFFER",
  154027. "parameters": {
  154028. },
  154029. "attributes": {
  154030. "module_not_derived": "00000000000000000000000000000001",
  154031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154032. },
  154033. "port_directions": {
  154034. "C": "input",
  154035. "D": "input",
  154036. "E": "input",
  154037. "Q": "output",
  154038. "R": "input"
  154039. },
  154040. "connections": {
  154041. "C": [ 42 ],
  154042. "D": [ 6421 ],
  154043. "E": [ 6360 ],
  154044. "Q": [ 6396 ],
  154045. "R": [ 127 ]
  154046. }
  154047. },
  154048. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_3_SB_CARRY_I1": {
  154049. "hide_name": 0,
  154050. "type": "SB_CARRY",
  154051. "parameters": {
  154052. },
  154053. "attributes": {
  154054. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154055. },
  154056. "port_directions": {
  154057. "CI": "input",
  154058. "CO": "output",
  154059. "I0": "input",
  154060. "I1": "input"
  154061. },
  154062. "connections": {
  154063. "CI": [ 6422 ],
  154064. "CO": [ 6420 ],
  154065. "I0": [ "0" ],
  154066. "I1": [ 6395 ]
  154067. }
  154068. },
  154069. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_3_SB_DFFER_Q": {
  154070. "hide_name": 0,
  154071. "type": "SB_DFFER",
  154072. "parameters": {
  154073. },
  154074. "attributes": {
  154075. "module_not_derived": "00000000000000000000000000000001",
  154076. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154077. },
  154078. "port_directions": {
  154079. "C": "input",
  154080. "D": "input",
  154081. "E": "input",
  154082. "Q": "output",
  154083. "R": "input"
  154084. },
  154085. "connections": {
  154086. "C": [ 42 ],
  154087. "D": [ 6423 ],
  154088. "E": [ 6360 ],
  154089. "Q": [ 6395 ],
  154090. "R": [ 127 ]
  154091. }
  154092. },
  154093. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_4_SB_CARRY_I1": {
  154094. "hide_name": 0,
  154095. "type": "SB_CARRY",
  154096. "parameters": {
  154097. },
  154098. "attributes": {
  154099. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154100. },
  154101. "port_directions": {
  154102. "CI": "input",
  154103. "CO": "output",
  154104. "I0": "input",
  154105. "I1": "input"
  154106. },
  154107. "connections": {
  154108. "CI": [ 6424 ],
  154109. "CO": [ 6422 ],
  154110. "I0": [ "0" ],
  154111. "I1": [ 6394 ]
  154112. }
  154113. },
  154114. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_4_SB_DFFER_Q": {
  154115. "hide_name": 0,
  154116. "type": "SB_DFFER",
  154117. "parameters": {
  154118. },
  154119. "attributes": {
  154120. "module_not_derived": "00000000000000000000000000000001",
  154121. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154122. },
  154123. "port_directions": {
  154124. "C": "input",
  154125. "D": "input",
  154126. "E": "input",
  154127. "Q": "output",
  154128. "R": "input"
  154129. },
  154130. "connections": {
  154131. "C": [ 42 ],
  154132. "D": [ 6425 ],
  154133. "E": [ 6360 ],
  154134. "Q": [ 6394 ],
  154135. "R": [ 127 ]
  154136. }
  154137. },
  154138. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_5_SB_CARRY_I1": {
  154139. "hide_name": 0,
  154140. "type": "SB_CARRY",
  154141. "parameters": {
  154142. },
  154143. "attributes": {
  154144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154145. },
  154146. "port_directions": {
  154147. "CI": "input",
  154148. "CO": "output",
  154149. "I0": "input",
  154150. "I1": "input"
  154151. },
  154152. "connections": {
  154153. "CI": [ 6426 ],
  154154. "CO": [ 6424 ],
  154155. "I0": [ "0" ],
  154156. "I1": [ 6393 ]
  154157. }
  154158. },
  154159. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_5_SB_DFFER_Q": {
  154160. "hide_name": 0,
  154161. "type": "SB_DFFER",
  154162. "parameters": {
  154163. },
  154164. "attributes": {
  154165. "module_not_derived": "00000000000000000000000000000001",
  154166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154167. },
  154168. "port_directions": {
  154169. "C": "input",
  154170. "D": "input",
  154171. "E": "input",
  154172. "Q": "output",
  154173. "R": "input"
  154174. },
  154175. "connections": {
  154176. "C": [ 42 ],
  154177. "D": [ 6427 ],
  154178. "E": [ 6360 ],
  154179. "Q": [ 6393 ],
  154180. "R": [ 127 ]
  154181. }
  154182. },
  154183. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_6_SB_CARRY_I1": {
  154184. "hide_name": 0,
  154185. "type": "SB_CARRY",
  154186. "parameters": {
  154187. },
  154188. "attributes": {
  154189. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154190. },
  154191. "port_directions": {
  154192. "CI": "input",
  154193. "CO": "output",
  154194. "I0": "input",
  154195. "I1": "input"
  154196. },
  154197. "connections": {
  154198. "CI": [ 6428 ],
  154199. "CO": [ 6426 ],
  154200. "I0": [ "0" ],
  154201. "I1": [ 6392 ]
  154202. }
  154203. },
  154204. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_6_SB_DFFER_Q": {
  154205. "hide_name": 0,
  154206. "type": "SB_DFFER",
  154207. "parameters": {
  154208. },
  154209. "attributes": {
  154210. "module_not_derived": "00000000000000000000000000000001",
  154211. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154212. },
  154213. "port_directions": {
  154214. "C": "input",
  154215. "D": "input",
  154216. "E": "input",
  154217. "Q": "output",
  154218. "R": "input"
  154219. },
  154220. "connections": {
  154221. "C": [ 42 ],
  154222. "D": [ 6429 ],
  154223. "E": [ 6360 ],
  154224. "Q": [ 6392 ],
  154225. "R": [ 127 ]
  154226. }
  154227. },
  154228. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_7_SB_CARRY_I1": {
  154229. "hide_name": 0,
  154230. "type": "SB_CARRY",
  154231. "parameters": {
  154232. },
  154233. "attributes": {
  154234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154235. },
  154236. "port_directions": {
  154237. "CI": "input",
  154238. "CO": "output",
  154239. "I0": "input",
  154240. "I1": "input"
  154241. },
  154242. "connections": {
  154243. "CI": [ 6399 ],
  154244. "CO": [ 6428 ],
  154245. "I0": [ "0" ],
  154246. "I1": [ 6391 ]
  154247. }
  154248. },
  154249. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_7_SB_DFFER_Q": {
  154250. "hide_name": 0,
  154251. "type": "SB_DFFER",
  154252. "parameters": {
  154253. },
  154254. "attributes": {
  154255. "module_not_derived": "00000000000000000000000000000001",
  154256. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154257. },
  154258. "port_directions": {
  154259. "C": "input",
  154260. "D": "input",
  154261. "E": "input",
  154262. "Q": "output",
  154263. "R": "input"
  154264. },
  154265. "connections": {
  154266. "C": [ 42 ],
  154267. "D": [ 6430 ],
  154268. "E": [ 6360 ],
  154269. "Q": [ 6391 ],
  154270. "R": [ 127 ]
  154271. }
  154272. },
  154273. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_8_SB_DFFER_Q": {
  154274. "hide_name": 0,
  154275. "type": "SB_DFFER",
  154276. "parameters": {
  154277. },
  154278. "attributes": {
  154279. "module_not_derived": "00000000000000000000000000000001",
  154280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154281. },
  154282. "port_directions": {
  154283. "C": "input",
  154284. "D": "input",
  154285. "E": "input",
  154286. "Q": "output",
  154287. "R": "input"
  154288. },
  154289. "connections": {
  154290. "C": [ 42 ],
  154291. "D": [ 6431 ],
  154292. "E": [ 6360 ],
  154293. "Q": [ 6399 ],
  154294. "R": [ 127 ]
  154295. }
  154296. },
  154297. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_DFFER_Q": {
  154298. "hide_name": 0,
  154299. "type": "SB_DFFER",
  154300. "parameters": {
  154301. },
  154302. "attributes": {
  154303. "module_not_derived": "00000000000000000000000000000001",
  154304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:108.2-112.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154305. },
  154306. "port_directions": {
  154307. "C": "input",
  154308. "D": "input",
  154309. "E": "input",
  154310. "Q": "output",
  154311. "R": "input"
  154312. },
  154313. "connections": {
  154314. "C": [ 42 ],
  154315. "D": [ 6432 ],
  154316. "E": [ 6360 ],
  154317. "Q": [ 6398 ],
  154318. "R": [ 127 ]
  154319. }
  154320. },
  154321. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2": {
  154322. "hide_name": 0,
  154323. "type": "SB_LUT4",
  154324. "parameters": {
  154325. "LUT_INIT": "0110100110010110"
  154326. },
  154327. "attributes": {
  154328. "module_not_derived": "00000000000000000000000000000001",
  154329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154330. },
  154331. "port_directions": {
  154332. "I0": "input",
  154333. "I1": "input",
  154334. "I2": "input",
  154335. "I3": "input",
  154336. "O": "output"
  154337. },
  154338. "connections": {
  154339. "I0": [ "0" ],
  154340. "I1": [ "0" ],
  154341. "I2": [ 6398 ],
  154342. "I3": [ 6418 ],
  154343. "O": [ 6432 ]
  154344. }
  154345. },
  154346. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O": {
  154347. "hide_name": 0,
  154348. "type": "SB_LUT4",
  154349. "parameters": {
  154350. "LUT_INIT": "0110100110010110"
  154351. },
  154352. "attributes": {
  154353. "module_not_derived": "00000000000000000000000000000001",
  154354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154355. },
  154356. "port_directions": {
  154357. "I0": "input",
  154358. "I1": "input",
  154359. "I2": "input",
  154360. "I3": "input",
  154361. "O": "output"
  154362. },
  154363. "connections": {
  154364. "I0": [ "0" ],
  154365. "I1": [ "0" ],
  154366. "I2": [ 6392 ],
  154367. "I3": [ 6428 ],
  154368. "O": [ 6429 ]
  154369. }
  154370. },
  154371. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_1": {
  154372. "hide_name": 0,
  154373. "type": "SB_LUT4",
  154374. "parameters": {
  154375. "LUT_INIT": "0110100110010110"
  154376. },
  154377. "attributes": {
  154378. "module_not_derived": "00000000000000000000000000000001",
  154379. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154380. },
  154381. "port_directions": {
  154382. "I0": "input",
  154383. "I1": "input",
  154384. "I2": "input",
  154385. "I3": "input",
  154386. "O": "output"
  154387. },
  154388. "connections": {
  154389. "I0": [ "0" ],
  154390. "I1": [ "0" ],
  154391. "I2": [ 6391 ],
  154392. "I3": [ 6399 ],
  154393. "O": [ 6430 ]
  154394. }
  154395. },
  154396. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_2": {
  154397. "hide_name": 0,
  154398. "type": "SB_LUT4",
  154399. "parameters": {
  154400. "LUT_INIT": "0110100110010110"
  154401. },
  154402. "attributes": {
  154403. "module_not_derived": "00000000000000000000000000000001",
  154404. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154405. },
  154406. "port_directions": {
  154407. "I0": "input",
  154408. "I1": "input",
  154409. "I2": "input",
  154410. "I3": "input",
  154411. "O": "output"
  154412. },
  154413. "connections": {
  154414. "I0": [ "0" ],
  154415. "I1": [ "0" ],
  154416. "I2": [ 6393 ],
  154417. "I3": [ 6426 ],
  154418. "O": [ 6427 ]
  154419. }
  154420. },
  154421. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_3": {
  154422. "hide_name": 0,
  154423. "type": "SB_LUT4",
  154424. "parameters": {
  154425. "LUT_INIT": "0110100110010110"
  154426. },
  154427. "attributes": {
  154428. "module_not_derived": "00000000000000000000000000000001",
  154429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154430. },
  154431. "port_directions": {
  154432. "I0": "input",
  154433. "I1": "input",
  154434. "I2": "input",
  154435. "I3": "input",
  154436. "O": "output"
  154437. },
  154438. "connections": {
  154439. "I0": [ "0" ],
  154440. "I1": [ "0" ],
  154441. "I2": [ 6394 ],
  154442. "I3": [ 6424 ],
  154443. "O": [ 6425 ]
  154444. }
  154445. },
  154446. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_4": {
  154447. "hide_name": 0,
  154448. "type": "SB_LUT4",
  154449. "parameters": {
  154450. "LUT_INIT": "0110100110010110"
  154451. },
  154452. "attributes": {
  154453. "module_not_derived": "00000000000000000000000000000001",
  154454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154455. },
  154456. "port_directions": {
  154457. "I0": "input",
  154458. "I1": "input",
  154459. "I2": "input",
  154460. "I3": "input",
  154461. "O": "output"
  154462. },
  154463. "connections": {
  154464. "I0": [ "0" ],
  154465. "I1": [ "0" ],
  154466. "I2": [ 6395 ],
  154467. "I3": [ 6422 ],
  154468. "O": [ 6423 ]
  154469. }
  154470. },
  154471. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_5": {
  154472. "hide_name": 0,
  154473. "type": "SB_LUT4",
  154474. "parameters": {
  154475. "LUT_INIT": "0110100110010110"
  154476. },
  154477. "attributes": {
  154478. "module_not_derived": "00000000000000000000000000000001",
  154479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154480. },
  154481. "port_directions": {
  154482. "I0": "input",
  154483. "I1": "input",
  154484. "I2": "input",
  154485. "I3": "input",
  154486. "O": "output"
  154487. },
  154488. "connections": {
  154489. "I0": [ "0" ],
  154490. "I1": [ "0" ],
  154491. "I2": [ 6396 ],
  154492. "I3": [ 6420 ],
  154493. "O": [ 6421 ]
  154494. }
  154495. },
  154496. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_6": {
  154497. "hide_name": 0,
  154498. "type": "SB_LUT4",
  154499. "parameters": {
  154500. "LUT_INIT": "0110100110010110"
  154501. },
  154502. "attributes": {
  154503. "module_not_derived": "00000000000000000000000000000001",
  154504. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154505. },
  154506. "port_directions": {
  154507. "I0": "input",
  154508. "I1": "input",
  154509. "I2": "input",
  154510. "I3": "input",
  154511. "O": "output"
  154512. },
  154513. "connections": {
  154514. "I0": [ "0" ],
  154515. "I1": [ "0" ],
  154516. "I2": [ 6397 ],
  154517. "I3": [ 6417 ],
  154518. "O": [ 6419 ]
  154519. }
  154520. },
  154521. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_7": {
  154522. "hide_name": 0,
  154523. "type": "SB_LUT4",
  154524. "parameters": {
  154525. "LUT_INIT": "0000000011111111"
  154526. },
  154527. "attributes": {
  154528. "module_not_derived": "00000000000000000000000000000001",
  154529. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  154530. },
  154531. "port_directions": {
  154532. "I0": "input",
  154533. "I1": "input",
  154534. "I2": "input",
  154535. "I3": "input",
  154536. "O": "output"
  154537. },
  154538. "connections": {
  154539. "I0": [ "0" ],
  154540. "I1": [ "0" ],
  154541. "I2": [ "0" ],
  154542. "I3": [ 6399 ],
  154543. "O": [ 6431 ]
  154544. }
  154545. },
  154546. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_1_SB_CARRY_I1": {
  154547. "hide_name": 0,
  154548. "type": "SB_CARRY",
  154549. "parameters": {
  154550. },
  154551. "attributes": {
  154552. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154553. },
  154554. "port_directions": {
  154555. "CI": "input",
  154556. "CO": "output",
  154557. "I0": "input",
  154558. "I1": "input"
  154559. },
  154560. "connections": {
  154561. "CI": [ 6433 ],
  154562. "CO": [ 6434 ],
  154563. "I0": [ "0" ],
  154564. "I1": [ 6414 ]
  154565. }
  154566. },
  154567. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_1_SB_DFFER_Q": {
  154568. "hide_name": 0,
  154569. "type": "SB_DFFER",
  154570. "parameters": {
  154571. },
  154572. "attributes": {
  154573. "module_not_derived": "00000000000000000000000000000001",
  154574. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154575. },
  154576. "port_directions": {
  154577. "C": "input",
  154578. "D": "input",
  154579. "E": "input",
  154580. "Q": "output",
  154581. "R": "input"
  154582. },
  154583. "connections": {
  154584. "C": [ 42 ],
  154585. "D": [ 6435 ],
  154586. "E": [ 6355 ],
  154587. "Q": [ 6414 ],
  154588. "R": [ 127 ]
  154589. }
  154590. },
  154591. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_2_SB_CARRY_I1": {
  154592. "hide_name": 0,
  154593. "type": "SB_CARRY",
  154594. "parameters": {
  154595. },
  154596. "attributes": {
  154597. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154598. },
  154599. "port_directions": {
  154600. "CI": "input",
  154601. "CO": "output",
  154602. "I0": "input",
  154603. "I1": "input"
  154604. },
  154605. "connections": {
  154606. "CI": [ 6436 ],
  154607. "CO": [ 6433 ],
  154608. "I0": [ "0" ],
  154609. "I1": [ 6413 ]
  154610. }
  154611. },
  154612. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_2_SB_DFFER_Q": {
  154613. "hide_name": 0,
  154614. "type": "SB_DFFER",
  154615. "parameters": {
  154616. },
  154617. "attributes": {
  154618. "module_not_derived": "00000000000000000000000000000001",
  154619. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154620. },
  154621. "port_directions": {
  154622. "C": "input",
  154623. "D": "input",
  154624. "E": "input",
  154625. "Q": "output",
  154626. "R": "input"
  154627. },
  154628. "connections": {
  154629. "C": [ 42 ],
  154630. "D": [ 6437 ],
  154631. "E": [ 6355 ],
  154632. "Q": [ 6413 ],
  154633. "R": [ 127 ]
  154634. }
  154635. },
  154636. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_3_SB_CARRY_I1": {
  154637. "hide_name": 0,
  154638. "type": "SB_CARRY",
  154639. "parameters": {
  154640. },
  154641. "attributes": {
  154642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154643. },
  154644. "port_directions": {
  154645. "CI": "input",
  154646. "CO": "output",
  154647. "I0": "input",
  154648. "I1": "input"
  154649. },
  154650. "connections": {
  154651. "CI": [ 6438 ],
  154652. "CO": [ 6436 ],
  154653. "I0": [ "0" ],
  154654. "I1": [ 6412 ]
  154655. }
  154656. },
  154657. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_3_SB_DFFER_Q": {
  154658. "hide_name": 0,
  154659. "type": "SB_DFFER",
  154660. "parameters": {
  154661. },
  154662. "attributes": {
  154663. "module_not_derived": "00000000000000000000000000000001",
  154664. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154665. },
  154666. "port_directions": {
  154667. "C": "input",
  154668. "D": "input",
  154669. "E": "input",
  154670. "Q": "output",
  154671. "R": "input"
  154672. },
  154673. "connections": {
  154674. "C": [ 42 ],
  154675. "D": [ 6439 ],
  154676. "E": [ 6355 ],
  154677. "Q": [ 6412 ],
  154678. "R": [ 127 ]
  154679. }
  154680. },
  154681. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_4_SB_CARRY_I1": {
  154682. "hide_name": 0,
  154683. "type": "SB_CARRY",
  154684. "parameters": {
  154685. },
  154686. "attributes": {
  154687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154688. },
  154689. "port_directions": {
  154690. "CI": "input",
  154691. "CO": "output",
  154692. "I0": "input",
  154693. "I1": "input"
  154694. },
  154695. "connections": {
  154696. "CI": [ 6440 ],
  154697. "CO": [ 6438 ],
  154698. "I0": [ "0" ],
  154699. "I1": [ 6411 ]
  154700. }
  154701. },
  154702. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_4_SB_DFFER_Q": {
  154703. "hide_name": 0,
  154704. "type": "SB_DFFER",
  154705. "parameters": {
  154706. },
  154707. "attributes": {
  154708. "module_not_derived": "00000000000000000000000000000001",
  154709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154710. },
  154711. "port_directions": {
  154712. "C": "input",
  154713. "D": "input",
  154714. "E": "input",
  154715. "Q": "output",
  154716. "R": "input"
  154717. },
  154718. "connections": {
  154719. "C": [ 42 ],
  154720. "D": [ 6441 ],
  154721. "E": [ 6355 ],
  154722. "Q": [ 6411 ],
  154723. "R": [ 127 ]
  154724. }
  154725. },
  154726. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_5_SB_CARRY_I1": {
  154727. "hide_name": 0,
  154728. "type": "SB_CARRY",
  154729. "parameters": {
  154730. },
  154731. "attributes": {
  154732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154733. },
  154734. "port_directions": {
  154735. "CI": "input",
  154736. "CO": "output",
  154737. "I0": "input",
  154738. "I1": "input"
  154739. },
  154740. "connections": {
  154741. "CI": [ 6442 ],
  154742. "CO": [ 6440 ],
  154743. "I0": [ "0" ],
  154744. "I1": [ 6410 ]
  154745. }
  154746. },
  154747. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_5_SB_DFFER_Q": {
  154748. "hide_name": 0,
  154749. "type": "SB_DFFER",
  154750. "parameters": {
  154751. },
  154752. "attributes": {
  154753. "module_not_derived": "00000000000000000000000000000001",
  154754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154755. },
  154756. "port_directions": {
  154757. "C": "input",
  154758. "D": "input",
  154759. "E": "input",
  154760. "Q": "output",
  154761. "R": "input"
  154762. },
  154763. "connections": {
  154764. "C": [ 42 ],
  154765. "D": [ 6443 ],
  154766. "E": [ 6355 ],
  154767. "Q": [ 6410 ],
  154768. "R": [ 127 ]
  154769. }
  154770. },
  154771. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_6_SB_CARRY_I1": {
  154772. "hide_name": 0,
  154773. "type": "SB_CARRY",
  154774. "parameters": {
  154775. },
  154776. "attributes": {
  154777. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154778. },
  154779. "port_directions": {
  154780. "CI": "input",
  154781. "CO": "output",
  154782. "I0": "input",
  154783. "I1": "input"
  154784. },
  154785. "connections": {
  154786. "CI": [ 6444 ],
  154787. "CO": [ 6442 ],
  154788. "I0": [ "0" ],
  154789. "I1": [ 6409 ]
  154790. }
  154791. },
  154792. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_6_SB_DFFER_Q": {
  154793. "hide_name": 0,
  154794. "type": "SB_DFFER",
  154795. "parameters": {
  154796. },
  154797. "attributes": {
  154798. "module_not_derived": "00000000000000000000000000000001",
  154799. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154800. },
  154801. "port_directions": {
  154802. "C": "input",
  154803. "D": "input",
  154804. "E": "input",
  154805. "Q": "output",
  154806. "R": "input"
  154807. },
  154808. "connections": {
  154809. "C": [ 42 ],
  154810. "D": [ 6445 ],
  154811. "E": [ 6355 ],
  154812. "Q": [ 6409 ],
  154813. "R": [ 127 ]
  154814. }
  154815. },
  154816. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_7_SB_CARRY_I1": {
  154817. "hide_name": 0,
  154818. "type": "SB_CARRY",
  154819. "parameters": {
  154820. },
  154821. "attributes": {
  154822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  154823. },
  154824. "port_directions": {
  154825. "CI": "input",
  154826. "CO": "output",
  154827. "I0": "input",
  154828. "I1": "input"
  154829. },
  154830. "connections": {
  154831. "CI": [ 6416 ],
  154832. "CO": [ 6444 ],
  154833. "I0": [ "0" ],
  154834. "I1": [ 6408 ]
  154835. }
  154836. },
  154837. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_7_SB_DFFER_Q": {
  154838. "hide_name": 0,
  154839. "type": "SB_DFFER",
  154840. "parameters": {
  154841. },
  154842. "attributes": {
  154843. "module_not_derived": "00000000000000000000000000000001",
  154844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154845. },
  154846. "port_directions": {
  154847. "C": "input",
  154848. "D": "input",
  154849. "E": "input",
  154850. "Q": "output",
  154851. "R": "input"
  154852. },
  154853. "connections": {
  154854. "C": [ 42 ],
  154855. "D": [ 6446 ],
  154856. "E": [ 6355 ],
  154857. "Q": [ 6408 ],
  154858. "R": [ 127 ]
  154859. }
  154860. },
  154861. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_8_SB_DFFER_Q": {
  154862. "hide_name": 0,
  154863. "type": "SB_DFFER",
  154864. "parameters": {
  154865. },
  154866. "attributes": {
  154867. "module_not_derived": "00000000000000000000000000000001",
  154868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154869. },
  154870. "port_directions": {
  154871. "C": "input",
  154872. "D": "input",
  154873. "E": "input",
  154874. "Q": "output",
  154875. "R": "input"
  154876. },
  154877. "connections": {
  154878. "C": [ 42 ],
  154879. "D": [ 6447 ],
  154880. "E": [ 6355 ],
  154881. "Q": [ 6416 ],
  154882. "R": [ 127 ]
  154883. }
  154884. },
  154885. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_DFFER_Q": {
  154886. "hide_name": 0,
  154887. "type": "SB_DFFER",
  154888. "parameters": {
  154889. },
  154890. "attributes": {
  154891. "module_not_derived": "00000000000000000000000000000001",
  154892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:95.2-99.35|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116"
  154893. },
  154894. "port_directions": {
  154895. "C": "input",
  154896. "D": "input",
  154897. "E": "input",
  154898. "Q": "output",
  154899. "R": "input"
  154900. },
  154901. "connections": {
  154902. "C": [ 42 ],
  154903. "D": [ 6448 ],
  154904. "E": [ 6355 ],
  154905. "Q": [ 6415 ],
  154906. "R": [ 127 ]
  154907. }
  154908. },
  154909. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2": {
  154910. "hide_name": 0,
  154911. "type": "SB_LUT4",
  154912. "parameters": {
  154913. "LUT_INIT": "0110100110010110"
  154914. },
  154915. "attributes": {
  154916. "module_not_derived": "00000000000000000000000000000001",
  154917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154918. },
  154919. "port_directions": {
  154920. "I0": "input",
  154921. "I1": "input",
  154922. "I2": "input",
  154923. "I3": "input",
  154924. "O": "output"
  154925. },
  154926. "connections": {
  154927. "I0": [ "0" ],
  154928. "I1": [ "0" ],
  154929. "I2": [ 6415 ],
  154930. "I3": [ 6434 ],
  154931. "O": [ 6448 ]
  154932. }
  154933. },
  154934. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O": {
  154935. "hide_name": 0,
  154936. "type": "SB_LUT4",
  154937. "parameters": {
  154938. "LUT_INIT": "0110100110010110"
  154939. },
  154940. "attributes": {
  154941. "module_not_derived": "00000000000000000000000000000001",
  154942. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154943. },
  154944. "port_directions": {
  154945. "I0": "input",
  154946. "I1": "input",
  154947. "I2": "input",
  154948. "I3": "input",
  154949. "O": "output"
  154950. },
  154951. "connections": {
  154952. "I0": [ "0" ],
  154953. "I1": [ "0" ],
  154954. "I2": [ 6411 ],
  154955. "I3": [ 6440 ],
  154956. "O": [ 6441 ]
  154957. }
  154958. },
  154959. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_1": {
  154960. "hide_name": 0,
  154961. "type": "SB_LUT4",
  154962. "parameters": {
  154963. "LUT_INIT": "0110100110010110"
  154964. },
  154965. "attributes": {
  154966. "module_not_derived": "00000000000000000000000000000001",
  154967. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154968. },
  154969. "port_directions": {
  154970. "I0": "input",
  154971. "I1": "input",
  154972. "I2": "input",
  154973. "I3": "input",
  154974. "O": "output"
  154975. },
  154976. "connections": {
  154977. "I0": [ "0" ],
  154978. "I1": [ "0" ],
  154979. "I2": [ 6414 ],
  154980. "I3": [ 6433 ],
  154981. "O": [ 6435 ]
  154982. }
  154983. },
  154984. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_2": {
  154985. "hide_name": 0,
  154986. "type": "SB_LUT4",
  154987. "parameters": {
  154988. "LUT_INIT": "0110100110010110"
  154989. },
  154990. "attributes": {
  154991. "module_not_derived": "00000000000000000000000000000001",
  154992. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  154993. },
  154994. "port_directions": {
  154995. "I0": "input",
  154996. "I1": "input",
  154997. "I2": "input",
  154998. "I3": "input",
  154999. "O": "output"
  155000. },
  155001. "connections": {
  155002. "I0": [ "0" ],
  155003. "I1": [ "0" ],
  155004. "I2": [ 6408 ],
  155005. "I3": [ 6416 ],
  155006. "O": [ 6446 ]
  155007. }
  155008. },
  155009. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_3": {
  155010. "hide_name": 0,
  155011. "type": "SB_LUT4",
  155012. "parameters": {
  155013. "LUT_INIT": "0110100110010110"
  155014. },
  155015. "attributes": {
  155016. "module_not_derived": "00000000000000000000000000000001",
  155017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155018. },
  155019. "port_directions": {
  155020. "I0": "input",
  155021. "I1": "input",
  155022. "I2": "input",
  155023. "I3": "input",
  155024. "O": "output"
  155025. },
  155026. "connections": {
  155027. "I0": [ "0" ],
  155028. "I1": [ "0" ],
  155029. "I2": [ 6409 ],
  155030. "I3": [ 6444 ],
  155031. "O": [ 6445 ]
  155032. }
  155033. },
  155034. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_4": {
  155035. "hide_name": 0,
  155036. "type": "SB_LUT4",
  155037. "parameters": {
  155038. "LUT_INIT": "0110100110010110"
  155039. },
  155040. "attributes": {
  155041. "module_not_derived": "00000000000000000000000000000001",
  155042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155043. },
  155044. "port_directions": {
  155045. "I0": "input",
  155046. "I1": "input",
  155047. "I2": "input",
  155048. "I3": "input",
  155049. "O": "output"
  155050. },
  155051. "connections": {
  155052. "I0": [ "0" ],
  155053. "I1": [ "0" ],
  155054. "I2": [ 6410 ],
  155055. "I3": [ 6442 ],
  155056. "O": [ 6443 ]
  155057. }
  155058. },
  155059. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_5": {
  155060. "hide_name": 0,
  155061. "type": "SB_LUT4",
  155062. "parameters": {
  155063. "LUT_INIT": "0110100110010110"
  155064. },
  155065. "attributes": {
  155066. "module_not_derived": "00000000000000000000000000000001",
  155067. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155068. },
  155069. "port_directions": {
  155070. "I0": "input",
  155071. "I1": "input",
  155072. "I2": "input",
  155073. "I3": "input",
  155074. "O": "output"
  155075. },
  155076. "connections": {
  155077. "I0": [ "0" ],
  155078. "I1": [ "0" ],
  155079. "I2": [ 6412 ],
  155080. "I3": [ 6438 ],
  155081. "O": [ 6439 ]
  155082. }
  155083. },
  155084. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_6": {
  155085. "hide_name": 0,
  155086. "type": "SB_LUT4",
  155087. "parameters": {
  155088. "LUT_INIT": "0110100110010110"
  155089. },
  155090. "attributes": {
  155091. "module_not_derived": "00000000000000000000000000000001",
  155092. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155093. },
  155094. "port_directions": {
  155095. "I0": "input",
  155096. "I1": "input",
  155097. "I2": "input",
  155098. "I3": "input",
  155099. "O": "output"
  155100. },
  155101. "connections": {
  155102. "I0": [ "0" ],
  155103. "I1": [ "0" ],
  155104. "I2": [ 6413 ],
  155105. "I3": [ 6436 ],
  155106. "O": [ 6437 ]
  155107. }
  155108. },
  155109. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_7": {
  155110. "hide_name": 0,
  155111. "type": "SB_LUT4",
  155112. "parameters": {
  155113. "LUT_INIT": "0000000011111111"
  155114. },
  155115. "attributes": {
  155116. "module_not_derived": "00000000000000000000000000000001",
  155117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  155118. },
  155119. "port_directions": {
  155120. "I0": "input",
  155121. "I1": "input",
  155122. "I2": "input",
  155123. "I3": "input",
  155124. "O": "output"
  155125. },
  155126. "connections": {
  155127. "I0": [ "0" ],
  155128. "I1": [ "0" ],
  155129. "I2": [ "0" ],
  155130. "I3": [ 6416 ],
  155131. "O": [ 6447 ]
  155132. }
  155133. },
  155134. "uart_I.uart_tx_fifo_I.ram_rd_ena_SB_LUT4_O": {
  155135. "hide_name": 0,
  155136. "type": "SB_LUT4",
  155137. "parameters": {
  155138. "LUT_INIT": "0000000011001111"
  155139. },
  155140. "attributes": {
  155141. "module_not_derived": "00000000000000000000000000000001",
  155142. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  155143. },
  155144. "port_directions": {
  155145. "I0": "input",
  155146. "I1": "input",
  155147. "I2": "input",
  155148. "I3": "input",
  155149. "O": "output"
  155150. },
  155151. "connections": {
  155152. "I0": [ "0" ],
  155153. "I1": [ 6258 ],
  155154. "I2": [ 6259 ],
  155155. "I3": [ 6260 ],
  155156. "O": [ 6360 ]
  155157. }
  155158. },
  155159. "uart_I.uart_tx_fifo_I.ram_rd_ena_SB_LUT4_O_I3_SB_DFFS_Q": {
  155160. "hide_name": 0,
  155161. "type": "SB_DFFS",
  155162. "parameters": {
  155163. },
  155164. "attributes": {
  155165. "module_not_derived": "00000000000000000000000000000001",
  155166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  155167. },
  155168. "port_directions": {
  155169. "C": "input",
  155170. "D": "input",
  155171. "Q": "output",
  155172. "S": "input"
  155173. },
  155174. "connections": {
  155175. "C": [ 42 ],
  155176. "D": [ 6376 ],
  155177. "Q": [ 6260 ],
  155178. "S": [ 127 ]
  155179. }
  155180. },
  155181. "uart_I.ub_ack_SB_DFFSR_Q": {
  155182. "hide_name": 0,
  155183. "type": "SB_DFFSR",
  155184. "parameters": {
  155185. },
  155186. "attributes": {
  155187. "module_not_derived": "00000000000000000000000000000001",
  155188. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:177.2-181.65|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155189. },
  155190. "port_directions": {
  155191. "C": "input",
  155192. "D": "input",
  155193. "Q": "output",
  155194. "R": "input"
  155195. },
  155196. "connections": {
  155197. "C": [ 42 ],
  155198. "D": [ 6449 ],
  155199. "Q": [ 5979 ],
  155200. "R": [ 5979 ]
  155201. }
  155202. },
  155203. "uart_I.ub_ack_SB_DFFSR_Q_D_SB_LUT4_O": {
  155204. "hide_name": 0,
  155205. "type": "SB_LUT4",
  155206. "parameters": {
  155207. "LUT_INIT": "0000000011110000"
  155208. },
  155209. "attributes": {
  155210. "module_not_derived": "00000000000000000000000000000001",
  155211. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  155212. },
  155213. "port_directions": {
  155214. "I0": "input",
  155215. "I1": "input",
  155216. "I2": "input",
  155217. "I3": "input",
  155218. "O": "output"
  155219. },
  155220. "connections": {
  155221. "I0": [ "0" ],
  155222. "I1": [ "0" ],
  155223. "I2": [ 6450 ],
  155224. "I3": [ 6451 ],
  155225. "O": [ 6449 ]
  155226. }
  155227. },
  155228. "uart_I.ub_ack_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  155229. "hide_name": 0,
  155230. "type": "SB_LUT4",
  155231. "parameters": {
  155232. "LUT_INIT": "1000110000000000"
  155233. },
  155234. "attributes": {
  155235. "module_not_derived": "00000000000000000000000000000001",
  155236. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155237. },
  155238. "port_directions": {
  155239. "I0": "input",
  155240. "I1": "input",
  155241. "I2": "input",
  155242. "I3": "input",
  155243. "O": "output"
  155244. },
  155245. "connections": {
  155246. "I0": [ 704 ],
  155247. "I1": [ 469 ],
  155248. "I2": [ 706 ],
  155249. "I3": [ 6354 ],
  155250. "O": [ 6451 ]
  155251. }
  155252. },
  155253. "uart_I.ub_rd_ctrl_SB_DFFSR_Q": {
  155254. "hide_name": 0,
  155255. "type": "SB_DFFSR",
  155256. "parameters": {
  155257. },
  155258. "attributes": {
  155259. "module_not_derived": "00000000000000000000000000000001",
  155260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:164.2-175.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155261. },
  155262. "port_directions": {
  155263. "C": "input",
  155264. "D": "input",
  155265. "Q": "output",
  155266. "R": "input"
  155267. },
  155268. "connections": {
  155269. "C": [ 42 ],
  155270. "D": [ 6452 ],
  155271. "Q": [ 6453 ],
  155272. "R": [ 5979 ]
  155273. }
  155274. },
  155275. "uart_I.ub_rd_ctrl_SB_DFFSR_Q_D_SB_LUT4_O": {
  155276. "hide_name": 0,
  155277. "type": "SB_LUT4",
  155278. "parameters": {
  155279. "LUT_INIT": "0000001000000000"
  155280. },
  155281. "attributes": {
  155282. "module_not_derived": "00000000000000000000000000000001",
  155283. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155284. },
  155285. "port_directions": {
  155286. "I0": "input",
  155287. "I1": "input",
  155288. "I2": "input",
  155289. "I3": "input",
  155290. "O": "output"
  155291. },
  155292. "connections": {
  155293. "I0": [ 6450 ],
  155294. "I1": [ 704 ],
  155295. "I2": [ 469 ],
  155296. "I3": [ 706 ],
  155297. "O": [ 6452 ]
  155298. }
  155299. },
  155300. "uart_I.ub_rd_ctrl_SB_LUT4_I2": {
  155301. "hide_name": 0,
  155302. "type": "SB_LUT4",
  155303. "parameters": {
  155304. "LUT_INIT": "0011111100000000"
  155305. },
  155306. "attributes": {
  155307. "module_not_derived": "00000000000000000000000000000001",
  155308. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  155309. },
  155310. "port_directions": {
  155311. "I0": "input",
  155312. "I1": "input",
  155313. "I2": "input",
  155314. "I3": "input",
  155315. "O": "output"
  155316. },
  155317. "connections": {
  155318. "I0": [ "0" ],
  155319. "I1": [ 6454 ],
  155320. "I2": [ 6453 ],
  155321. "I3": [ 6455 ],
  155322. "O": [ 6171 ]
  155323. }
  155324. },
  155325. "uart_I.ub_rd_data_SB_DFFSR_Q": {
  155326. "hide_name": 0,
  155327. "type": "SB_DFFSR",
  155328. "parameters": {
  155329. },
  155330. "attributes": {
  155331. "module_not_derived": "00000000000000000000000000000001",
  155332. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:164.2-175.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155333. },
  155334. "port_directions": {
  155335. "C": "input",
  155336. "D": "input",
  155337. "Q": "output",
  155338. "R": "input"
  155339. },
  155340. "connections": {
  155341. "C": [ 42 ],
  155342. "D": [ 6456 ],
  155343. "Q": [ 6255 ],
  155344. "R": [ 5979 ]
  155345. }
  155346. },
  155347. "uart_I.ub_rd_data_SB_DFFSR_Q_D_SB_LUT4_O": {
  155348. "hide_name": 0,
  155349. "type": "SB_LUT4",
  155350. "parameters": {
  155351. "LUT_INIT": "0000000000000010"
  155352. },
  155353. "attributes": {
  155354. "module_not_derived": "00000000000000000000000000000001",
  155355. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155356. },
  155357. "port_directions": {
  155358. "I0": "input",
  155359. "I1": "input",
  155360. "I2": "input",
  155361. "I3": "input",
  155362. "O": "output"
  155363. },
  155364. "connections": {
  155365. "I0": [ 6450 ],
  155366. "I1": [ 704 ],
  155367. "I2": [ 469 ],
  155368. "I3": [ 706 ],
  155369. "O": [ 6456 ]
  155370. }
  155371. },
  155372. "uart_I.ub_rd_data_SB_LUT4_I1": {
  155373. "hide_name": 0,
  155374. "type": "SB_LUT4",
  155375. "parameters": {
  155376. "LUT_INIT": "1011000011111111"
  155377. },
  155378. "attributes": {
  155379. "module_not_derived": "00000000000000000000000000000001",
  155380. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155381. },
  155382. "port_directions": {
  155383. "I0": "input",
  155384. "I1": "input",
  155385. "I2": "input",
  155386. "I3": "input",
  155387. "O": "output"
  155388. },
  155389. "connections": {
  155390. "I0": [ 6254 ],
  155391. "I1": [ 6255 ],
  155392. "I2": [ 6256 ],
  155393. "I3": [ 6143 ],
  155394. "O": [ 6457 ]
  155395. }
  155396. },
  155397. "uart_I.ub_rd_data_SB_LUT4_I1_1": {
  155398. "hide_name": 0,
  155399. "type": "SB_LUT4",
  155400. "parameters": {
  155401. "LUT_INIT": "1011101110110000"
  155402. },
  155403. "attributes": {
  155404. "module_not_derived": "00000000000000000000000000000001",
  155405. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155406. },
  155407. "port_directions": {
  155408. "I0": "input",
  155409. "I1": "input",
  155410. "I2": "input",
  155411. "I3": "input",
  155412. "O": "output"
  155413. },
  155414. "connections": {
  155415. "I0": [ 6254 ],
  155416. "I1": [ 6255 ],
  155417. "I2": [ 6170 ],
  155418. "I3": [ 6458 ],
  155419. "O": [ 6459 ]
  155420. }
  155421. },
  155422. "uart_I.ub_rd_data_SB_LUT4_I1_1_I3_SB_LUT4_O": {
  155423. "hide_name": 0,
  155424. "type": "SB_LUT4",
  155425. "parameters": {
  155426. "LUT_INIT": "1100000000000000"
  155427. },
  155428. "attributes": {
  155429. "module_not_derived": "00000000000000000000000000000001",
  155430. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  155431. },
  155432. "port_directions": {
  155433. "I0": "input",
  155434. "I1": "input",
  155435. "I2": "input",
  155436. "I3": "input",
  155437. "O": "output"
  155438. },
  155439. "connections": {
  155440. "I0": [ "0" ],
  155441. "I1": [ 6144 ],
  155442. "I2": [ 6154 ],
  155443. "I3": [ 6150 ],
  155444. "O": [ 6458 ]
  155445. }
  155446. },
  155447. "uart_I.ub_rd_data_SB_LUT4_I1_1_O_SB_DFFR_D": {
  155448. "hide_name": 0,
  155449. "type": "SB_DFFR",
  155450. "parameters": {
  155451. },
  155452. "attributes": {
  155453. "module_not_derived": "00000000000000000000000000000001",
  155454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:83.2-87.73|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  155455. },
  155456. "port_directions": {
  155457. "C": "input",
  155458. "D": "input",
  155459. "Q": "output",
  155460. "R": "input"
  155461. },
  155462. "connections": {
  155463. "C": [ 42 ],
  155464. "D": [ 6459 ],
  155465. "Q": [ 6170 ],
  155466. "R": [ 127 ]
  155467. }
  155468. },
  155469. "uart_I.ub_rd_data_SB_LUT4_I1_O_SB_DFFR_D": {
  155470. "hide_name": 0,
  155471. "type": "SB_DFFR",
  155472. "parameters": {
  155473. },
  155474. "attributes": {
  155475. "module_not_derived": "00000000000000000000000000000001",
  155476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:116.2-120.27|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  155477. },
  155478. "port_directions": {
  155479. "C": "input",
  155480. "D": "input",
  155481. "Q": "output",
  155482. "R": "input"
  155483. },
  155484. "connections": {
  155485. "C": [ 42 ],
  155486. "D": [ 6457 ],
  155487. "Q": [ 6256 ],
  155488. "R": [ 127 ]
  155489. }
  155490. },
  155491. "uart_I.ub_rd_data_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_DFFS_Q": {
  155492. "hide_name": 0,
  155493. "type": "SB_DFFS",
  155494. "parameters": {
  155495. },
  155496. "attributes": {
  155497. "module_not_derived": "00000000000000000000000000000001",
  155498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:67.2-71.52|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  155499. },
  155500. "port_directions": {
  155501. "C": "input",
  155502. "D": "input",
  155503. "Q": "output",
  155504. "S": "input"
  155505. },
  155506. "connections": {
  155507. "C": [ 42 ],
  155508. "D": [ 6179 ],
  155509. "Q": [ 6143 ],
  155510. "S": [ 127 ]
  155511. }
  155512. },
  155513. "uart_I.ub_rdata_SB_DFFSR_Q": {
  155514. "hide_name": 0,
  155515. "type": "SB_DFFSR",
  155516. "parameters": {
  155517. },
  155518. "attributes": {
  155519. "module_not_derived": "00000000000000000000000000000001",
  155520. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155521. },
  155522. "port_directions": {
  155523. "C": "input",
  155524. "D": "input",
  155525. "Q": "output",
  155526. "R": "input"
  155527. },
  155528. "connections": {
  155529. "C": [ 42 ],
  155530. "D": [ 6455 ],
  155531. "Q": [ 6454 ],
  155532. "R": [ 6460 ]
  155533. }
  155534. },
  155535. "uart_I.ub_rdata_SB_DFFSR_Q_1": {
  155536. "hide_name": 0,
  155537. "type": "SB_DFFSR",
  155538. "parameters": {
  155539. },
  155540. "attributes": {
  155541. "module_not_derived": "00000000000000000000000000000001",
  155542. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155543. },
  155544. "port_directions": {
  155545. "C": "input",
  155546. "D": "input",
  155547. "Q": "output",
  155548. "R": "input"
  155549. },
  155550. "connections": {
  155551. "C": [ 42 ],
  155552. "D": [ 6461 ],
  155553. "Q": [ 6462 ],
  155554. "R": [ 6460 ]
  155555. }
  155556. },
  155557. "uart_I.ub_rdata_SB_DFFSR_Q_10": {
  155558. "hide_name": 0,
  155559. "type": "SB_DFFSR",
  155560. "parameters": {
  155561. },
  155562. "attributes": {
  155563. "module_not_derived": "00000000000000000000000000000001",
  155564. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155565. },
  155566. "port_directions": {
  155567. "C": "input",
  155568. "D": "input",
  155569. "Q": "output",
  155570. "R": "input"
  155571. },
  155572. "connections": {
  155573. "C": [ 42 ],
  155574. "D": [ 6251 ],
  155575. "Q": [ 6463 ],
  155576. "R": [ 6464 ]
  155577. }
  155578. },
  155579. "uart_I.ub_rdata_SB_DFFSR_Q_11": {
  155580. "hide_name": 0,
  155581. "type": "SB_DFFSR",
  155582. "parameters": {
  155583. },
  155584. "attributes": {
  155585. "module_not_derived": "00000000000000000000000000000001",
  155586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155587. },
  155588. "port_directions": {
  155589. "C": "input",
  155590. "D": "input",
  155591. "Q": "output",
  155592. "R": "input"
  155593. },
  155594. "connections": {
  155595. "C": [ 42 ],
  155596. "D": [ 6250 ],
  155597. "Q": [ 6465 ],
  155598. "R": [ 6464 ]
  155599. }
  155600. },
  155601. "uart_I.ub_rdata_SB_DFFSR_Q_12": {
  155602. "hide_name": 0,
  155603. "type": "SB_DFFSR",
  155604. "parameters": {
  155605. },
  155606. "attributes": {
  155607. "module_not_derived": "00000000000000000000000000000001",
  155608. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155609. },
  155610. "port_directions": {
  155611. "C": "input",
  155612. "D": "input",
  155613. "Q": "output",
  155614. "R": "input"
  155615. },
  155616. "connections": {
  155617. "C": [ 42 ],
  155618. "D": [ 6249 ],
  155619. "Q": [ 6466 ],
  155620. "R": [ 6464 ]
  155621. }
  155622. },
  155623. "uart_I.ub_rdata_SB_DFFSR_Q_13": {
  155624. "hide_name": 0,
  155625. "type": "SB_DFFSR",
  155626. "parameters": {
  155627. },
  155628. "attributes": {
  155629. "module_not_derived": "00000000000000000000000000000001",
  155630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155631. },
  155632. "port_directions": {
  155633. "C": "input",
  155634. "D": "input",
  155635. "Q": "output",
  155636. "R": "input"
  155637. },
  155638. "connections": {
  155639. "C": [ 42 ],
  155640. "D": [ 6248 ],
  155641. "Q": [ 6467 ],
  155642. "R": [ 6464 ]
  155643. }
  155644. },
  155645. "uart_I.ub_rdata_SB_DFFSR_Q_14": {
  155646. "hide_name": 0,
  155647. "type": "SB_DFFSR",
  155648. "parameters": {
  155649. },
  155650. "attributes": {
  155651. "module_not_derived": "00000000000000000000000000000001",
  155652. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155653. },
  155654. "port_directions": {
  155655. "C": "input",
  155656. "D": "input",
  155657. "Q": "output",
  155658. "R": "input"
  155659. },
  155660. "connections": {
  155661. "C": [ 42 ],
  155662. "D": [ 6247 ],
  155663. "Q": [ 6468 ],
  155664. "R": [ 6464 ]
  155665. }
  155666. },
  155667. "uart_I.ub_rdata_SB_DFFSR_Q_15": {
  155668. "hide_name": 0,
  155669. "type": "SB_DFFSR",
  155670. "parameters": {
  155671. },
  155672. "attributes": {
  155673. "module_not_derived": "00000000000000000000000000000001",
  155674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155675. },
  155676. "port_directions": {
  155677. "C": "input",
  155678. "D": "input",
  155679. "Q": "output",
  155680. "R": "input"
  155681. },
  155682. "connections": {
  155683. "C": [ 42 ],
  155684. "D": [ 6253 ],
  155685. "Q": [ 6469 ],
  155686. "R": [ 6464 ]
  155687. }
  155688. },
  155689. "uart_I.ub_rdata_SB_DFFSR_Q_2": {
  155690. "hide_name": 0,
  155691. "type": "SB_DFFSR",
  155692. "parameters": {
  155693. },
  155694. "attributes": {
  155695. "module_not_derived": "00000000000000000000000000000001",
  155696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155697. },
  155698. "port_directions": {
  155699. "C": "input",
  155700. "D": "input",
  155701. "Q": "output",
  155702. "R": "input"
  155703. },
  155704. "connections": {
  155705. "C": [ 42 ],
  155706. "D": [ 6354 ],
  155707. "Q": [ 6470 ],
  155708. "R": [ 6460 ]
  155709. }
  155710. },
  155711. "uart_I.ub_rdata_SB_DFFSR_Q_3": {
  155712. "hide_name": 0,
  155713. "type": "SB_DFFSR",
  155714. "parameters": {
  155715. },
  155716. "attributes": {
  155717. "module_not_derived": "00000000000000000000000000000001",
  155718. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155719. },
  155720. "port_directions": {
  155721. "C": "input",
  155722. "D": "input",
  155723. "Q": "output",
  155724. "R": "input"
  155725. },
  155726. "connections": {
  155727. "C": [ 42 ],
  155728. "D": [ 6011 ],
  155729. "Q": [ 6471 ],
  155730. "R": [ 6460 ]
  155731. }
  155732. },
  155733. "uart_I.ub_rdata_SB_DFFSR_Q_4": {
  155734. "hide_name": 0,
  155735. "type": "SB_DFFSR",
  155736. "parameters": {
  155737. },
  155738. "attributes": {
  155739. "module_not_derived": "00000000000000000000000000000001",
  155740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155741. },
  155742. "port_directions": {
  155743. "C": "input",
  155744. "D": "input",
  155745. "Q": "output",
  155746. "R": "input"
  155747. },
  155748. "connections": {
  155749. "C": [ 42 ],
  155750. "D": [ 6012 ],
  155751. "Q": [ 6472 ],
  155752. "R": [ 6460 ]
  155753. }
  155754. },
  155755. "uart_I.ub_rdata_SB_DFFSR_Q_5": {
  155756. "hide_name": 0,
  155757. "type": "SB_DFFSR",
  155758. "parameters": {
  155759. },
  155760. "attributes": {
  155761. "module_not_derived": "00000000000000000000000000000001",
  155762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155763. },
  155764. "port_directions": {
  155765. "C": "input",
  155766. "D": "input",
  155767. "Q": "output",
  155768. "R": "input"
  155769. },
  155770. "connections": {
  155771. "C": [ 42 ],
  155772. "D": [ 6015 ],
  155773. "Q": [ 6473 ],
  155774. "R": [ 6460 ]
  155775. }
  155776. },
  155777. "uart_I.ub_rdata_SB_DFFSR_Q_6": {
  155778. "hide_name": 0,
  155779. "type": "SB_DFFSR",
  155780. "parameters": {
  155781. },
  155782. "attributes": {
  155783. "module_not_derived": "00000000000000000000000000000001",
  155784. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155785. },
  155786. "port_directions": {
  155787. "C": "input",
  155788. "D": "input",
  155789. "Q": "output",
  155790. "R": "input"
  155791. },
  155792. "connections": {
  155793. "C": [ 42 ],
  155794. "D": [ 6016 ],
  155795. "Q": [ 6474 ],
  155796. "R": [ 6460 ]
  155797. }
  155798. },
  155799. "uart_I.ub_rdata_SB_DFFSR_Q_7": {
  155800. "hide_name": 0,
  155801. "type": "SB_DFFSR",
  155802. "parameters": {
  155803. },
  155804. "attributes": {
  155805. "module_not_derived": "00000000000000000000000000000001",
  155806. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155807. },
  155808. "port_directions": {
  155809. "C": "input",
  155810. "D": "input",
  155811. "Q": "output",
  155812. "R": "input"
  155813. },
  155814. "connections": {
  155815. "C": [ 42 ],
  155816. "D": [ 6475 ],
  155817. "Q": [ 6254 ],
  155818. "R": [ 6464 ]
  155819. }
  155820. },
  155821. "uart_I.ub_rdata_SB_DFFSR_Q_8": {
  155822. "hide_name": 0,
  155823. "type": "SB_DFFSR",
  155824. "parameters": {
  155825. },
  155826. "attributes": {
  155827. "module_not_derived": "00000000000000000000000000000001",
  155828. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155829. },
  155830. "port_directions": {
  155831. "C": "input",
  155832. "D": "input",
  155833. "Q": "output",
  155834. "R": "input"
  155835. },
  155836. "connections": {
  155837. "C": [ 42 ],
  155838. "D": [ 6246 ],
  155839. "Q": [ 6476 ],
  155840. "R": [ 6464 ]
  155841. }
  155842. },
  155843. "uart_I.ub_rdata_SB_DFFSR_Q_9": {
  155844. "hide_name": 0,
  155845. "type": "SB_DFFSR",
  155846. "parameters": {
  155847. },
  155848. "attributes": {
  155849. "module_not_derived": "00000000000000000000000000000001",
  155850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:185.2-191.48|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  155851. },
  155852. "port_directions": {
  155853. "C": "input",
  155854. "D": "input",
  155855. "Q": "output",
  155856. "R": "input"
  155857. },
  155858. "connections": {
  155859. "C": [ 42 ],
  155860. "D": [ 6252 ],
  155861. "Q": [ 6477 ],
  155862. "R": [ 6464 ]
  155863. }
  155864. },
  155865. "uart_I.ub_rdata_SB_DFFSR_Q_R_SB_LUT4_O": {
  155866. "hide_name": 0,
  155867. "type": "SB_LUT4",
  155868. "parameters": {
  155869. "LUT_INIT": "1111111100001111"
  155870. },
  155871. "attributes": {
  155872. "module_not_derived": "00000000000000000000000000000001",
  155873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  155874. },
  155875. "port_directions": {
  155876. "I0": "input",
  155877. "I1": "input",
  155878. "I2": "input",
  155879. "I3": "input",
  155880. "O": "output"
  155881. },
  155882. "connections": {
  155883. "I0": [ "0" ],
  155884. "I1": [ "0" ],
  155885. "I2": [ 706 ],
  155886. "I3": [ 6464 ],
  155887. "O": [ 6460 ]
  155888. }
  155889. },
  155890. "uart_I.ub_rdata_SB_LUT4_I0": {
  155891. "hide_name": 0,
  155892. "type": "SB_LUT4",
  155893. "parameters": {
  155894. "LUT_INIT": "1110101011111111"
  155895. },
  155896. "attributes": {
  155897. "module_not_derived": "00000000000000000000000000000001",
  155898. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155899. },
  155900. "port_directions": {
  155901. "I0": "input",
  155902. "I1": "input",
  155903. "I2": "input",
  155904. "I3": "input",
  155905. "O": "output"
  155906. },
  155907. "connections": {
  155908. "I0": [ 6468 ],
  155909. "I1": [ 6478 ],
  155910. "I2": [ 6479 ],
  155911. "I3": [ 6480 ],
  155912. "O": [ 880 ]
  155913. }
  155914. },
  155915. "uart_I.ub_rdata_SB_LUT4_I0_1": {
  155916. "hide_name": 0,
  155917. "type": "SB_LUT4",
  155918. "parameters": {
  155919. "LUT_INIT": "1110101011111111"
  155920. },
  155921. "attributes": {
  155922. "module_not_derived": "00000000000000000000000000000001",
  155923. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155924. },
  155925. "port_directions": {
  155926. "I0": "input",
  155927. "I1": "input",
  155928. "I2": "input",
  155929. "I3": "input",
  155930. "O": "output"
  155931. },
  155932. "connections": {
  155933. "I0": [ 6467 ],
  155934. "I1": [ 6481 ],
  155935. "I2": [ 6479 ],
  155936. "I3": [ 6482 ],
  155937. "O": [ 878 ]
  155938. }
  155939. },
  155940. "uart_I.ub_rdata_SB_LUT4_I0_10": {
  155941. "hide_name": 0,
  155942. "type": "SB_LUT4",
  155943. "parameters": {
  155944. "LUT_INIT": "1110101011111111"
  155945. },
  155946. "attributes": {
  155947. "module_not_derived": "00000000000000000000000000000001",
  155948. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155949. },
  155950. "port_directions": {
  155951. "I0": "input",
  155952. "I1": "input",
  155953. "I2": "input",
  155954. "I3": "input",
  155955. "O": "output"
  155956. },
  155957. "connections": {
  155958. "I0": [ 6471 ],
  155959. "I1": [ 6483 ],
  155960. "I2": [ 6479 ],
  155961. "I3": [ 6484 ],
  155962. "O": [ 869 ]
  155963. }
  155964. },
  155965. "uart_I.ub_rdata_SB_LUT4_I0_11": {
  155966. "hide_name": 0,
  155967. "type": "SB_LUT4",
  155968. "parameters": {
  155969. "LUT_INIT": "1111111011101110"
  155970. },
  155971. "attributes": {
  155972. "module_not_derived": "00000000000000000000000000000001",
  155973. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155974. },
  155975. "port_directions": {
  155976. "I0": "input",
  155977. "I1": "input",
  155978. "I2": "input",
  155979. "I3": "input",
  155980. "O": "output"
  155981. },
  155982. "connections": {
  155983. "I0": [ 6470 ],
  155984. "I1": [ 5657 ],
  155985. "I2": [ 6485 ],
  155986. "I3": [ 6479 ],
  155987. "O": [ 879 ]
  155988. }
  155989. },
  155990. "uart_I.ub_rdata_SB_LUT4_I0_12": {
  155991. "hide_name": 0,
  155992. "type": "SB_LUT4",
  155993. "parameters": {
  155994. "LUT_INIT": "1111111011111010"
  155995. },
  155996. "attributes": {
  155997. "module_not_derived": "00000000000000000000000000000001",
  155998. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  155999. },
  156000. "port_directions": {
  156001. "I0": "input",
  156002. "I1": "input",
  156003. "I2": "input",
  156004. "I3": "input",
  156005. "O": "output"
  156006. },
  156007. "connections": {
  156008. "I0": [ 6462 ],
  156009. "I1": [ 6486 ],
  156010. "I2": [ 5646 ],
  156011. "I3": [ 6479 ],
  156012. "O": [ 868 ]
  156013. }
  156014. },
  156015. "uart_I.ub_rdata_SB_LUT4_I0_13": {
  156016. "hide_name": 0,
  156017. "type": "SB_LUT4",
  156018. "parameters": {
  156019. "LUT_INIT": "1111111011101110"
  156020. },
  156021. "attributes": {
  156022. "module_not_derived": "00000000000000000000000000000001",
  156023. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156024. },
  156025. "port_directions": {
  156026. "I0": "input",
  156027. "I1": "input",
  156028. "I2": "input",
  156029. "I3": "input",
  156030. "O": "output"
  156031. },
  156032. "connections": {
  156033. "I0": [ 6454 ],
  156034. "I1": [ 5635 ],
  156035. "I2": [ 6487 ],
  156036. "I3": [ 6479 ],
  156037. "O": [ 857 ]
  156038. }
  156039. },
  156040. "uart_I.ub_rdata_SB_LUT4_I0_14": {
  156041. "hide_name": 0,
  156042. "type": "SB_LUT4",
  156043. "parameters": {
  156044. "LUT_INIT": "1111111011101110"
  156045. },
  156046. "attributes": {
  156047. "module_not_derived": "00000000000000000000000000000001",
  156048. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156049. },
  156050. "port_directions": {
  156051. "I0": "input",
  156052. "I1": "input",
  156053. "I2": "input",
  156054. "I3": "input",
  156055. "O": "output"
  156056. },
  156057. "connections": {
  156058. "I0": [ 6254 ],
  156059. "I1": [ 5634 ],
  156060. "I2": [ 6488 ],
  156061. "I3": [ 6479 ],
  156062. "O": [ 856 ]
  156063. }
  156064. },
  156065. "uart_I.ub_rdata_SB_LUT4_I0_15": {
  156066. "hide_name": 0,
  156067. "type": "SB_LUT4",
  156068. "parameters": {
  156069. "LUT_INIT": "1110101011111111"
  156070. },
  156071. "attributes": {
  156072. "module_not_derived": "00000000000000000000000000000001",
  156073. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156074. },
  156075. "port_directions": {
  156076. "I0": "input",
  156077. "I1": "input",
  156078. "I2": "input",
  156079. "I3": "input",
  156080. "O": "output"
  156081. },
  156082. "connections": {
  156083. "I0": [ 6469 ],
  156084. "I1": [ 6489 ],
  156085. "I2": [ 6479 ],
  156086. "I3": [ 6490 ],
  156087. "O": [ 881 ]
  156088. }
  156089. },
  156090. "uart_I.ub_rdata_SB_LUT4_I0_2": {
  156091. "hide_name": 0,
  156092. "type": "SB_LUT4",
  156093. "parameters": {
  156094. "LUT_INIT": "1110101011111111"
  156095. },
  156096. "attributes": {
  156097. "module_not_derived": "00000000000000000000000000000001",
  156098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156099. },
  156100. "port_directions": {
  156101. "I0": "input",
  156102. "I1": "input",
  156103. "I2": "input",
  156104. "I3": "input",
  156105. "O": "output"
  156106. },
  156107. "connections": {
  156108. "I0": [ 6466 ],
  156109. "I1": [ 6491 ],
  156110. "I2": [ 6479 ],
  156111. "I3": [ 6492 ],
  156112. "O": [ 877 ]
  156113. }
  156114. },
  156115. "uart_I.ub_rdata_SB_LUT4_I0_3": {
  156116. "hide_name": 0,
  156117. "type": "SB_LUT4",
  156118. "parameters": {
  156119. "LUT_INIT": "1110101011111111"
  156120. },
  156121. "attributes": {
  156122. "module_not_derived": "00000000000000000000000000000001",
  156123. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156124. },
  156125. "port_directions": {
  156126. "I0": "input",
  156127. "I1": "input",
  156128. "I2": "input",
  156129. "I3": "input",
  156130. "O": "output"
  156131. },
  156132. "connections": {
  156133. "I0": [ 6465 ],
  156134. "I1": [ 6493 ],
  156135. "I2": [ 6479 ],
  156136. "I3": [ 6494 ],
  156137. "O": [ 876 ]
  156138. }
  156139. },
  156140. "uart_I.ub_rdata_SB_LUT4_I0_4": {
  156141. "hide_name": 0,
  156142. "type": "SB_LUT4",
  156143. "parameters": {
  156144. "LUT_INIT": "1110101011111111"
  156145. },
  156146. "attributes": {
  156147. "module_not_derived": "00000000000000000000000000000001",
  156148. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156149. },
  156150. "port_directions": {
  156151. "I0": "input",
  156152. "I1": "input",
  156153. "I2": "input",
  156154. "I3": "input",
  156155. "O": "output"
  156156. },
  156157. "connections": {
  156158. "I0": [ 6463 ],
  156159. "I1": [ 6495 ],
  156160. "I2": [ 6479 ],
  156161. "I3": [ 6496 ],
  156162. "O": [ 875 ]
  156163. }
  156164. },
  156165. "uart_I.ub_rdata_SB_LUT4_I0_5": {
  156166. "hide_name": 0,
  156167. "type": "SB_LUT4",
  156168. "parameters": {
  156169. "LUT_INIT": "1110101011111111"
  156170. },
  156171. "attributes": {
  156172. "module_not_derived": "00000000000000000000000000000001",
  156173. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156174. },
  156175. "port_directions": {
  156176. "I0": "input",
  156177. "I1": "input",
  156178. "I2": "input",
  156179. "I3": "input",
  156180. "O": "output"
  156181. },
  156182. "connections": {
  156183. "I0": [ 6477 ],
  156184. "I1": [ 6497 ],
  156185. "I2": [ 6479 ],
  156186. "I3": [ 6498 ],
  156187. "O": [ 874 ]
  156188. }
  156189. },
  156190. "uart_I.ub_rdata_SB_LUT4_I0_6": {
  156191. "hide_name": 0,
  156192. "type": "SB_LUT4",
  156193. "parameters": {
  156194. "LUT_INIT": "1110101011111111"
  156195. },
  156196. "attributes": {
  156197. "module_not_derived": "00000000000000000000000000000001",
  156198. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156199. },
  156200. "port_directions": {
  156201. "I0": "input",
  156202. "I1": "input",
  156203. "I2": "input",
  156204. "I3": "input",
  156205. "O": "output"
  156206. },
  156207. "connections": {
  156208. "I0": [ 6476 ],
  156209. "I1": [ 6499 ],
  156210. "I2": [ 6479 ],
  156211. "I3": [ 6500 ],
  156212. "O": [ 873 ]
  156213. }
  156214. },
  156215. "uart_I.ub_rdata_SB_LUT4_I0_7": {
  156216. "hide_name": 0,
  156217. "type": "SB_LUT4",
  156218. "parameters": {
  156219. "LUT_INIT": "1110101011111111"
  156220. },
  156221. "attributes": {
  156222. "module_not_derived": "00000000000000000000000000000001",
  156223. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156224. },
  156225. "port_directions": {
  156226. "I0": "input",
  156227. "I1": "input",
  156228. "I2": "input",
  156229. "I3": "input",
  156230. "O": "output"
  156231. },
  156232. "connections": {
  156233. "I0": [ 6474 ],
  156234. "I1": [ 6501 ],
  156235. "I2": [ 6479 ],
  156236. "I3": [ 6502 ],
  156237. "O": [ 872 ]
  156238. }
  156239. },
  156240. "uart_I.ub_rdata_SB_LUT4_I0_8": {
  156241. "hide_name": 0,
  156242. "type": "SB_LUT4",
  156243. "parameters": {
  156244. "LUT_INIT": "1110101011111111"
  156245. },
  156246. "attributes": {
  156247. "module_not_derived": "00000000000000000000000000000001",
  156248. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156249. },
  156250. "port_directions": {
  156251. "I0": "input",
  156252. "I1": "input",
  156253. "I2": "input",
  156254. "I3": "input",
  156255. "O": "output"
  156256. },
  156257. "connections": {
  156258. "I0": [ 6473 ],
  156259. "I1": [ 6503 ],
  156260. "I2": [ 6479 ],
  156261. "I3": [ 6504 ],
  156262. "O": [ 871 ]
  156263. }
  156264. },
  156265. "uart_I.ub_rdata_SB_LUT4_I0_9": {
  156266. "hide_name": 0,
  156267. "type": "SB_LUT4",
  156268. "parameters": {
  156269. "LUT_INIT": "1110101011111111"
  156270. },
  156271. "attributes": {
  156272. "module_not_derived": "00000000000000000000000000000001",
  156273. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156274. },
  156275. "port_directions": {
  156276. "I0": "input",
  156277. "I1": "input",
  156278. "I2": "input",
  156279. "I3": "input",
  156280. "O": "output"
  156281. },
  156282. "connections": {
  156283. "I0": [ 6472 ],
  156284. "I1": [ 6505 ],
  156285. "I2": [ 6479 ],
  156286. "I3": [ 6506 ],
  156287. "O": [ 870 ]
  156288. }
  156289. },
  156290. "uart_I.ub_wr_data_SB_DFFSR_Q": {
  156291. "hide_name": 0,
  156292. "type": "SB_DFFSR",
  156293. "parameters": {
  156294. },
  156295. "attributes": {
  156296. "module_not_derived": "00000000000000000000000000000001",
  156297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:164.2-175.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  156298. },
  156299. "port_directions": {
  156300. "C": "input",
  156301. "D": "input",
  156302. "Q": "output",
  156303. "R": "input"
  156304. },
  156305. "connections": {
  156306. "C": [ 42 ],
  156307. "D": [ 6507 ],
  156308. "Q": [ 6355 ],
  156309. "R": [ 5979 ]
  156310. }
  156311. },
  156312. "uart_I.ub_wr_data_SB_DFFSR_Q_D_SB_LUT4_O": {
  156313. "hide_name": 0,
  156314. "type": "SB_LUT4",
  156315. "parameters": {
  156316. "LUT_INIT": "0000111100000000"
  156317. },
  156318. "attributes": {
  156319. "module_not_derived": "00000000000000000000000000000001",
  156320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  156321. },
  156322. "port_directions": {
  156323. "I0": "input",
  156324. "I1": "input",
  156325. "I2": "input",
  156326. "I3": "input",
  156327. "O": "output"
  156328. },
  156329. "connections": {
  156330. "I0": [ "0" ],
  156331. "I1": [ "0" ],
  156332. "I2": [ 6354 ],
  156333. "I3": [ 6508 ],
  156334. "O": [ 6507 ]
  156335. }
  156336. },
  156337. "uart_I.ub_wr_data_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_LUT4_O": {
  156338. "hide_name": 0,
  156339. "type": "SB_LUT4",
  156340. "parameters": {
  156341. "LUT_INIT": "0000000000100000"
  156342. },
  156343. "attributes": {
  156344. "module_not_derived": "00000000000000000000000000000001",
  156345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156346. },
  156347. "port_directions": {
  156348. "I0": "input",
  156349. "I1": "input",
  156350. "I2": "input",
  156351. "I3": "input",
  156352. "O": "output"
  156353. },
  156354. "connections": {
  156355. "I0": [ 6450 ],
  156356. "I1": [ 704 ],
  156357. "I2": [ 469 ],
  156358. "I3": [ 706 ],
  156359. "O": [ 6508 ]
  156360. }
  156361. },
  156362. "uart_I.ub_wr_div_SB_DFFSR_Q": {
  156363. "hide_name": 0,
  156364. "type": "SB_DFFSR",
  156365. "parameters": {
  156366. },
  156367. "attributes": {
  156368. "module_not_derived": "00000000000000000000000000000001",
  156369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:164.2-175.6|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  156370. },
  156371. "port_directions": {
  156372. "C": "input",
  156373. "D": "input",
  156374. "Q": "output",
  156375. "R": "input"
  156376. },
  156377. "connections": {
  156378. "C": [ 42 ],
  156379. "D": [ 6509 ],
  156380. "Q": [ 6010 ],
  156381. "R": [ 5979 ]
  156382. }
  156383. },
  156384. "uart_I.ub_wr_div_SB_DFFSR_Q_D_SB_LUT4_O": {
  156385. "hide_name": 0,
  156386. "type": "SB_LUT4",
  156387. "parameters": {
  156388. "LUT_INIT": "0010000000000000"
  156389. },
  156390. "attributes": {
  156391. "module_not_derived": "00000000000000000000000000000001",
  156392. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156393. },
  156394. "port_directions": {
  156395. "I0": "input",
  156396. "I1": "input",
  156397. "I2": "input",
  156398. "I3": "input",
  156399. "O": "output"
  156400. },
  156401. "connections": {
  156402. "I0": [ 6450 ],
  156403. "I1": [ 704 ],
  156404. "I2": [ 469 ],
  156405. "I3": [ 706 ],
  156406. "O": [ 6509 ]
  156407. }
  156408. },
  156409. "uart_I.urf_empty_SB_LUT4_O": {
  156410. "hide_name": 0,
  156411. "type": "SB_LUT4",
  156412. "parameters": {
  156413. "LUT_INIT": "0000000011111111"
  156414. },
  156415. "attributes": {
  156416. "module_not_derived": "00000000000000000000000000000001",
  156417. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  156418. },
  156419. "port_directions": {
  156420. "I0": "input",
  156421. "I1": "input",
  156422. "I2": "input",
  156423. "I3": "input",
  156424. "O": "output"
  156425. },
  156426. "connections": {
  156427. "I0": [ "0" ],
  156428. "I1": [ "0" ],
  156429. "I2": [ "0" ],
  156430. "I3": [ 6256 ],
  156431. "O": [ 6475 ]
  156432. }
  156433. },
  156434. "uart_I.urf_overflow_SB_DFFR_Q": {
  156435. "hide_name": 0,
  156436. "type": "SB_DFFR",
  156437. "parameters": {
  156438. },
  156439. "attributes": {
  156440. "module_not_derived": "00000000000000000000000000000001",
  156441. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:154.2-158.82|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  156442. },
  156443. "port_directions": {
  156444. "C": "input",
  156445. "D": "input",
  156446. "Q": "output",
  156447. "R": "input"
  156448. },
  156449. "connections": {
  156450. "C": [ 42 ],
  156451. "D": [ 6172 ],
  156452. "Q": [ 6455 ],
  156453. "R": [ 127 ]
  156454. }
  156455. },
  156456. "uart_I.utf_empty_SB_LUT4_O": {
  156457. "hide_name": 0,
  156458. "type": "SB_LUT4",
  156459. "parameters": {
  156460. "LUT_INIT": "0000000011111111"
  156461. },
  156462. "attributes": {
  156463. "module_not_derived": "00000000000000000000000000000001",
  156464. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  156465. },
  156466. "port_directions": {
  156467. "I0": "input",
  156468. "I1": "input",
  156469. "I2": "input",
  156470. "I3": "input",
  156471. "O": "output"
  156472. },
  156473. "connections": {
  156474. "I0": [ "0" ],
  156475. "I1": [ "0" ],
  156476. "I2": [ "0" ],
  156477. "I3": [ 6259 ],
  156478. "O": [ 6461 ]
  156479. }
  156480. },
  156481. "uart_I.wb_cyc_SB_DFFSR_Q": {
  156482. "hide_name": 0,
  156483. "type": "SB_DFFSR",
  156484. "parameters": {
  156485. },
  156486. "attributes": {
  156487. "module_not_derived": "00000000000000000000000000000001",
  156488. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:294.2-302.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  156489. },
  156490. "port_directions": {
  156491. "C": "input",
  156492. "D": "input",
  156493. "Q": "output",
  156494. "R": "input"
  156495. },
  156496. "connections": {
  156497. "C": [ 42 ],
  156498. "D": [ 6510 ],
  156499. "Q": [ 6450 ],
  156500. "R": [ 127 ]
  156501. }
  156502. },
  156503. "uart_I.wb_cyc_SB_DFFSR_Q_D_SB_LUT4_O": {
  156504. "hide_name": 0,
  156505. "type": "SB_LUT4",
  156506. "parameters": {
  156507. "LUT_INIT": "0101110100001100"
  156508. },
  156509. "attributes": {
  156510. "module_not_derived": "00000000000000000000000000000001",
  156511. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  156512. },
  156513. "port_directions": {
  156514. "I0": "input",
  156515. "I1": "input",
  156516. "I2": "input",
  156517. "I3": "input",
  156518. "O": "output"
  156519. },
  156520. "connections": {
  156521. "I0": [ 687 ],
  156522. "I1": [ 6450 ],
  156523. "I2": [ 5979 ],
  156524. "I3": [ 5978 ],
  156525. "O": [ 6510 ]
  156526. }
  156527. },
  156528. "uart_I.wb_cyc_SB_LUT4_I1": {
  156529. "hide_name": 0,
  156530. "type": "SB_LUT4",
  156531. "parameters": {
  156532. "LUT_INIT": "1111111111110011"
  156533. },
  156534. "attributes": {
  156535. "module_not_derived": "00000000000000000000000000000001",
  156536. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  156537. },
  156538. "port_directions": {
  156539. "I0": "input",
  156540. "I1": "input",
  156541. "I2": "input",
  156542. "I3": "input",
  156543. "O": "output"
  156544. },
  156545. "connections": {
  156546. "I0": [ "0" ],
  156547. "I1": [ 6450 ],
  156548. "I2": [ 5979 ],
  156549. "I3": [ 469 ],
  156550. "O": [ 6464 ]
  156551. }
  156552. },
  156553. "uart_tx_SB_DFFES_Q": {
  156554. "hide_name": 0,
  156555. "type": "SB_DFFES",
  156556. "parameters": {
  156557. },
  156558. "attributes": {
  156559. "module_not_derived": "00000000000000000000000000000001",
  156560. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116"
  156561. },
  156562. "port_directions": {
  156563. "C": "input",
  156564. "D": "input",
  156565. "E": "input",
  156566. "Q": "output",
  156567. "S": "input"
  156568. },
  156569. "connections": {
  156570. "C": [ 42 ],
  156571. "D": [ 6352 ],
  156572. "E": [ 6327 ],
  156573. "Q": [ 26 ],
  156574. "S": [ 127 ]
  156575. }
  156576. },
  156577. "vid_I.dly_de.dl_SB_DFF_Q": {
  156578. "hide_name": 0,
  156579. "type": "SB_DFF",
  156580. "parameters": {
  156581. },
  156582. "attributes": {
  156583. "module_not_derived": "00000000000000000000000000000001",
  156584. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156585. },
  156586. "port_directions": {
  156587. "C": "input",
  156588. "D": "input",
  156589. "Q": "output"
  156590. },
  156591. "connections": {
  156592. "C": [ 42 ],
  156593. "D": [ 6511 ],
  156594. "Q": [ 6512 ]
  156595. }
  156596. },
  156597. "vid_I.dly_de.dl_SB_DFF_Q_1": {
  156598. "hide_name": 0,
  156599. "type": "SB_DFF",
  156600. "parameters": {
  156601. },
  156602. "attributes": {
  156603. "module_not_derived": "00000000000000000000000000000001",
  156604. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156605. },
  156606. "port_directions": {
  156607. "C": "input",
  156608. "D": "input",
  156609. "Q": "output"
  156610. },
  156611. "connections": {
  156612. "C": [ 42 ],
  156613. "D": [ 6513 ],
  156614. "Q": [ 6511 ]
  156615. }
  156616. },
  156617. "vid_I.dly_de.q_SB_DFF_Q": {
  156618. "hide_name": 0,
  156619. "type": "SB_DFF",
  156620. "parameters": {
  156621. },
  156622. "attributes": {
  156623. "module_not_derived": "00000000000000000000000000000001",
  156624. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156625. },
  156626. "port_directions": {
  156627. "C": "input",
  156628. "D": "input",
  156629. "Q": "output"
  156630. },
  156631. "connections": {
  156632. "C": [ 42 ],
  156633. "D": [ 6512 ],
  156634. "Q": [ 6514 ]
  156635. }
  156636. },
  156637. "vid_I.dly_hsync.d_SB_LUT4_O": {
  156638. "hide_name": 0,
  156639. "type": "SB_LUT4",
  156640. "parameters": {
  156641. "LUT_INIT": "0000000011111111"
  156642. },
  156643. "attributes": {
  156644. "module_not_derived": "00000000000000000000000000000001",
  156645. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  156646. },
  156647. "port_directions": {
  156648. "I0": "input",
  156649. "I1": "input",
  156650. "I2": "input",
  156651. "I3": "input",
  156652. "O": "output"
  156653. },
  156654. "connections": {
  156655. "I0": [ "0" ],
  156656. "I1": [ "0" ],
  156657. "I2": [ "0" ],
  156658. "I3": [ 6515 ],
  156659. "O": [ 6516 ]
  156660. }
  156661. },
  156662. "vid_I.dly_hsync.d_SB_LUT4_O_I3_SB_DFFR_Q": {
  156663. "hide_name": 0,
  156664. "type": "SB_DFFR",
  156665. "parameters": {
  156666. },
  156667. "attributes": {
  156668. "module_not_derived": "00000000000000000000000000000001",
  156669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  156670. },
  156671. "port_directions": {
  156672. "C": "input",
  156673. "D": "input",
  156674. "Q": "output",
  156675. "R": "input"
  156676. },
  156677. "connections": {
  156678. "C": [ 42 ],
  156679. "D": [ 6517 ],
  156680. "Q": [ 6515 ],
  156681. "R": [ 127 ]
  156682. }
  156683. },
  156684. "vid_I.dly_hsync.d_SB_LUT4_O_I3_SB_DFFR_Q_D_SB_LUT4_O": {
  156685. "hide_name": 0,
  156686. "type": "SB_LUT4",
  156687. "parameters": {
  156688. "LUT_INIT": "0000000011110000"
  156689. },
  156690. "attributes": {
  156691. "module_not_derived": "00000000000000000000000000000001",
  156692. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  156693. },
  156694. "port_directions": {
  156695. "I0": "input",
  156696. "I1": "input",
  156697. "I2": "input",
  156698. "I3": "input",
  156699. "O": "output"
  156700. },
  156701. "connections": {
  156702. "I0": [ "0" ],
  156703. "I1": [ "0" ],
  156704. "I2": [ 6518 ],
  156705. "I3": [ 6519 ],
  156706. "O": [ 6517 ]
  156707. }
  156708. },
  156709. "vid_I.dly_hsync.dl_SB_DFF_Q": {
  156710. "hide_name": 0,
  156711. "type": "SB_DFF",
  156712. "parameters": {
  156713. },
  156714. "attributes": {
  156715. "module_not_derived": "00000000000000000000000000000001",
  156716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156717. },
  156718. "port_directions": {
  156719. "C": "input",
  156720. "D": "input",
  156721. "Q": "output"
  156722. },
  156723. "connections": {
  156724. "C": [ 42 ],
  156725. "D": [ 6520 ],
  156726. "Q": [ 6521 ]
  156727. }
  156728. },
  156729. "vid_I.dly_hsync.dl_SB_DFF_Q_1": {
  156730. "hide_name": 0,
  156731. "type": "SB_DFF",
  156732. "parameters": {
  156733. },
  156734. "attributes": {
  156735. "module_not_derived": "00000000000000000000000000000001",
  156736. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156737. },
  156738. "port_directions": {
  156739. "C": "input",
  156740. "D": "input",
  156741. "Q": "output"
  156742. },
  156743. "connections": {
  156744. "C": [ 42 ],
  156745. "D": [ 6522 ],
  156746. "Q": [ 6520 ]
  156747. }
  156748. },
  156749. "vid_I.dly_hsync.dl_SB_DFF_Q_2": {
  156750. "hide_name": 0,
  156751. "type": "SB_DFF",
  156752. "parameters": {
  156753. },
  156754. "attributes": {
  156755. "module_not_derived": "00000000000000000000000000000001",
  156756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156757. },
  156758. "port_directions": {
  156759. "C": "input",
  156760. "D": "input",
  156761. "Q": "output"
  156762. },
  156763. "connections": {
  156764. "C": [ 42 ],
  156765. "D": [ 6516 ],
  156766. "Q": [ 6522 ]
  156767. }
  156768. },
  156769. "vid_I.dly_hsync.q_SB_DFF_Q": {
  156770. "hide_name": 0,
  156771. "type": "SB_DFF",
  156772. "parameters": {
  156773. },
  156774. "attributes": {
  156775. "module_not_derived": "00000000000000000000000000000001",
  156776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156777. },
  156778. "port_directions": {
  156779. "C": "input",
  156780. "D": "input",
  156781. "Q": "output"
  156782. },
  156783. "connections": {
  156784. "C": [ 42 ],
  156785. "D": [ 6521 ],
  156786. "Q": [ 6523 ]
  156787. }
  156788. },
  156789. "vid_I.dly_vsync.d_SB_LUT4_O": {
  156790. "hide_name": 0,
  156791. "type": "SB_LUT4",
  156792. "parameters": {
  156793. "LUT_INIT": "0000000011111111"
  156794. },
  156795. "attributes": {
  156796. "module_not_derived": "00000000000000000000000000000001",
  156797. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  156798. },
  156799. "port_directions": {
  156800. "I0": "input",
  156801. "I1": "input",
  156802. "I2": "input",
  156803. "I3": "input",
  156804. "O": "output"
  156805. },
  156806. "connections": {
  156807. "I0": [ "0" ],
  156808. "I1": [ "0" ],
  156809. "I2": [ "0" ],
  156810. "I3": [ 6524 ],
  156811. "O": [ 6525 ]
  156812. }
  156813. },
  156814. "vid_I.dly_vsync.d_SB_LUT4_O_I3_SB_DFFR_Q": {
  156815. "hide_name": 0,
  156816. "type": "SB_DFFR",
  156817. "parameters": {
  156818. },
  156819. "attributes": {
  156820. "module_not_derived": "00000000000000000000000000000001",
  156821. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  156822. },
  156823. "port_directions": {
  156824. "C": "input",
  156825. "D": "input",
  156826. "Q": "output",
  156827. "R": "input"
  156828. },
  156829. "connections": {
  156830. "C": [ 42 ],
  156831. "D": [ 6526 ],
  156832. "Q": [ 6524 ],
  156833. "R": [ 127 ]
  156834. }
  156835. },
  156836. "vid_I.dly_vsync.dl_SB_DFF_Q": {
  156837. "hide_name": 0,
  156838. "type": "SB_DFF",
  156839. "parameters": {
  156840. },
  156841. "attributes": {
  156842. "module_not_derived": "00000000000000000000000000000001",
  156843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156844. },
  156845. "port_directions": {
  156846. "C": "input",
  156847. "D": "input",
  156848. "Q": "output"
  156849. },
  156850. "connections": {
  156851. "C": [ 42 ],
  156852. "D": [ 6527 ],
  156853. "Q": [ 6528 ]
  156854. }
  156855. },
  156856. "vid_I.dly_vsync.dl_SB_DFF_Q_1": {
  156857. "hide_name": 0,
  156858. "type": "SB_DFF",
  156859. "parameters": {
  156860. },
  156861. "attributes": {
  156862. "module_not_derived": "00000000000000000000000000000001",
  156863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156864. },
  156865. "port_directions": {
  156866. "C": "input",
  156867. "D": "input",
  156868. "Q": "output"
  156869. },
  156870. "connections": {
  156871. "C": [ 42 ],
  156872. "D": [ 6529 ],
  156873. "Q": [ 6527 ]
  156874. }
  156875. },
  156876. "vid_I.dly_vsync.dl_SB_DFF_Q_2": {
  156877. "hide_name": 0,
  156878. "type": "SB_DFF",
  156879. "parameters": {
  156880. },
  156881. "attributes": {
  156882. "module_not_derived": "00000000000000000000000000000001",
  156883. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156884. },
  156885. "port_directions": {
  156886. "C": "input",
  156887. "D": "input",
  156888. "Q": "output"
  156889. },
  156890. "connections": {
  156891. "C": [ 42 ],
  156892. "D": [ 6525 ],
  156893. "Q": [ 6529 ]
  156894. }
  156895. },
  156896. "vid_I.dly_vsync.q_SB_DFF_Q": {
  156897. "hide_name": 0,
  156898. "type": "SB_DFF",
  156899. "parameters": {
  156900. },
  156901. "attributes": {
  156902. "module_not_derived": "00000000000000000000000000000001",
  156903. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  156904. },
  156905. "port_directions": {
  156906. "C": "input",
  156907. "D": "input",
  156908. "Q": "output"
  156909. },
  156910. "connections": {
  156911. "C": [ 42 ],
  156912. "D": [ 6528 ],
  156913. "Q": [ 6530 ]
  156914. }
  156915. },
  156916. "vid_I.fb_I.spram_I[0]": {
  156917. "hide_name": 0,
  156918. "type": "SB_SPRAM256KA",
  156919. "parameters": {
  156920. },
  156921. "attributes": {
  156922. "hdlname": "vid_I fb_I spram_I[0]",
  156923. "module_not_derived": "00000000000000000000000000000001",
  156924. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:45.16-56.3"
  156925. },
  156926. "port_directions": {
  156927. "ADDRESS": "input",
  156928. "CHIPSELECT": "input",
  156929. "CLOCK": "input",
  156930. "DATAIN": "input",
  156931. "DATAOUT": "output",
  156932. "MASKWREN": "input",
  156933. "POWEROFF": "input",
  156934. "SLEEP": "input",
  156935. "STANDBY": "input",
  156936. "WREN": "input"
  156937. },
  156938. "connections": {
  156939. "ADDRESS": [ 6531, 6532, 6533, 6534, 6535, 6536, 6537, 6538, 6539, 6540, 6541, 6542, 6543, 6544 ],
  156940. "CHIPSELECT": [ "1" ],
  156941. "CLOCK": [ 42 ],
  156942. "DATAIN": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75 ],
  156943. "DATAOUT": [ 6489, 6478, 6481, 6491, 6493, 6495, 6497, 6499, 6501, 6503, 6505, 6483, 6545, 6546, 6547, 6548 ],
  156944. "MASKWREN": [ 228, 228, 227, 227 ],
  156945. "POWEROFF": [ "1" ],
  156946. "SLEEP": [ "0" ],
  156947. "STANDBY": [ "0" ],
  156948. "WREN": [ 6549 ]
  156949. }
  156950. },
  156951. "vid_I.fb_I.spram_I[0]_ADDRESS_10_SB_LUT4_O": {
  156952. "hide_name": 0,
  156953. "type": "SB_LUT4",
  156954. "parameters": {
  156955. "LUT_INIT": "1111000011001100"
  156956. },
  156957. "attributes": {
  156958. "module_not_derived": "00000000000000000000000000000001",
  156959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  156960. },
  156961. "port_directions": {
  156962. "I0": "input",
  156963. "I1": "input",
  156964. "I2": "input",
  156965. "I3": "input",
  156966. "O": "output"
  156967. },
  156968. "connections": {
  156969. "I0": [ "0" ],
  156970. "I1": [ 699 ],
  156971. "I2": [ 6550 ],
  156972. "I3": [ 6551 ],
  156973. "O": [ 6534 ]
  156974. }
  156975. },
  156976. "vid_I.fb_I.spram_I[0]_ADDRESS_11_SB_LUT4_O": {
  156977. "hide_name": 0,
  156978. "type": "SB_LUT4",
  156979. "parameters": {
  156980. "LUT_INIT": "1111000011001100"
  156981. },
  156982. "attributes": {
  156983. "module_not_derived": "00000000000000000000000000000001",
  156984. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  156985. },
  156986. "port_directions": {
  156987. "I0": "input",
  156988. "I1": "input",
  156989. "I2": "input",
  156990. "I3": "input",
  156991. "O": "output"
  156992. },
  156993. "connections": {
  156994. "I0": [ "0" ],
  156995. "I1": [ 701 ],
  156996. "I2": [ 6552 ],
  156997. "I3": [ 6551 ],
  156998. "O": [ 6533 ]
  156999. }
  157000. },
  157001. "vid_I.fb_I.spram_I[0]_ADDRESS_12_SB_LUT4_O": {
  157002. "hide_name": 0,
  157003. "type": "SB_LUT4",
  157004. "parameters": {
  157005. "LUT_INIT": "1111000011001100"
  157006. },
  157007. "attributes": {
  157008. "module_not_derived": "00000000000000000000000000000001",
  157009. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157010. },
  157011. "port_directions": {
  157012. "I0": "input",
  157013. "I1": "input",
  157014. "I2": "input",
  157015. "I3": "input",
  157016. "O": "output"
  157017. },
  157018. "connections": {
  157019. "I0": [ "0" ],
  157020. "I1": [ 704 ],
  157021. "I2": [ 6553 ],
  157022. "I3": [ 6551 ],
  157023. "O": [ 6532 ]
  157024. }
  157025. },
  157026. "vid_I.fb_I.spram_I[0]_ADDRESS_13_SB_LUT4_O": {
  157027. "hide_name": 0,
  157028. "type": "SB_LUT4",
  157029. "parameters": {
  157030. "LUT_INIT": "1111000011001100"
  157031. },
  157032. "attributes": {
  157033. "module_not_derived": "00000000000000000000000000000001",
  157034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157035. },
  157036. "port_directions": {
  157037. "I0": "input",
  157038. "I1": "input",
  157039. "I2": "input",
  157040. "I3": "input",
  157041. "O": "output"
  157042. },
  157043. "connections": {
  157044. "I0": [ "0" ],
  157045. "I1": [ 706 ],
  157046. "I2": [ 6554 ],
  157047. "I3": [ 6551 ],
  157048. "O": [ 6531 ]
  157049. }
  157050. },
  157051. "vid_I.fb_I.spram_I[0]_ADDRESS_1_SB_LUT4_O": {
  157052. "hide_name": 0,
  157053. "type": "SB_LUT4",
  157054. "parameters": {
  157055. "LUT_INIT": "1111000011001100"
  157056. },
  157057. "attributes": {
  157058. "module_not_derived": "00000000000000000000000000000001",
  157059. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157060. },
  157061. "port_directions": {
  157062. "I0": "input",
  157063. "I1": "input",
  157064. "I2": "input",
  157065. "I3": "input",
  157066. "O": "output"
  157067. },
  157068. "connections": {
  157069. "I0": [ "0" ],
  157070. "I1": [ 682 ],
  157071. "I2": [ 6555 ],
  157072. "I3": [ 6551 ],
  157073. "O": [ 6543 ]
  157074. }
  157075. },
  157076. "vid_I.fb_I.spram_I[0]_ADDRESS_2_SB_LUT4_O": {
  157077. "hide_name": 0,
  157078. "type": "SB_LUT4",
  157079. "parameters": {
  157080. "LUT_INIT": "1111000011001100"
  157081. },
  157082. "attributes": {
  157083. "module_not_derived": "00000000000000000000000000000001",
  157084. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157085. },
  157086. "port_directions": {
  157087. "I0": "input",
  157088. "I1": "input",
  157089. "I2": "input",
  157090. "I3": "input",
  157091. "O": "output"
  157092. },
  157093. "connections": {
  157094. "I0": [ "0" ],
  157095. "I1": [ 710 ],
  157096. "I2": [ 6556 ],
  157097. "I3": [ 6551 ],
  157098. "O": [ 6542 ]
  157099. }
  157100. },
  157101. "vid_I.fb_I.spram_I[0]_ADDRESS_3_SB_LUT4_O": {
  157102. "hide_name": 0,
  157103. "type": "SB_LUT4",
  157104. "parameters": {
  157105. "LUT_INIT": "1111000011001100"
  157106. },
  157107. "attributes": {
  157108. "module_not_derived": "00000000000000000000000000000001",
  157109. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157110. },
  157111. "port_directions": {
  157112. "I0": "input",
  157113. "I1": "input",
  157114. "I2": "input",
  157115. "I3": "input",
  157116. "O": "output"
  157117. },
  157118. "connections": {
  157119. "I0": [ "0" ],
  157120. "I1": [ 712 ],
  157121. "I2": [ 6557 ],
  157122. "I3": [ 6551 ],
  157123. "O": [ 6541 ]
  157124. }
  157125. },
  157126. "vid_I.fb_I.spram_I[0]_ADDRESS_4_SB_LUT4_O": {
  157127. "hide_name": 0,
  157128. "type": "SB_LUT4",
  157129. "parameters": {
  157130. "LUT_INIT": "1111000011001100"
  157131. },
  157132. "attributes": {
  157133. "module_not_derived": "00000000000000000000000000000001",
  157134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157135. },
  157136. "port_directions": {
  157137. "I0": "input",
  157138. "I1": "input",
  157139. "I2": "input",
  157140. "I3": "input",
  157141. "O": "output"
  157142. },
  157143. "connections": {
  157144. "I0": [ "0" ],
  157145. "I1": [ 714 ],
  157146. "I2": [ 6558 ],
  157147. "I3": [ 6551 ],
  157148. "O": [ 6540 ]
  157149. }
  157150. },
  157151. "vid_I.fb_I.spram_I[0]_ADDRESS_5_SB_LUT4_O": {
  157152. "hide_name": 0,
  157153. "type": "SB_LUT4",
  157154. "parameters": {
  157155. "LUT_INIT": "1111000011001100"
  157156. },
  157157. "attributes": {
  157158. "module_not_derived": "00000000000000000000000000000001",
  157159. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157160. },
  157161. "port_directions": {
  157162. "I0": "input",
  157163. "I1": "input",
  157164. "I2": "input",
  157165. "I3": "input",
  157166. "O": "output"
  157167. },
  157168. "connections": {
  157169. "I0": [ "0" ],
  157170. "I1": [ 716 ],
  157171. "I2": [ 6559 ],
  157172. "I3": [ 6551 ],
  157173. "O": [ 6539 ]
  157174. }
  157175. },
  157176. "vid_I.fb_I.spram_I[0]_ADDRESS_6_SB_LUT4_O": {
  157177. "hide_name": 0,
  157178. "type": "SB_LUT4",
  157179. "parameters": {
  157180. "LUT_INIT": "1111000011001100"
  157181. },
  157182. "attributes": {
  157183. "module_not_derived": "00000000000000000000000000000001",
  157184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157185. },
  157186. "port_directions": {
  157187. "I0": "input",
  157188. "I1": "input",
  157189. "I2": "input",
  157190. "I3": "input",
  157191. "O": "output"
  157192. },
  157193. "connections": {
  157194. "I0": [ "0" ],
  157195. "I1": [ 691 ],
  157196. "I2": [ 6560 ],
  157197. "I3": [ 6551 ],
  157198. "O": [ 6538 ]
  157199. }
  157200. },
  157201. "vid_I.fb_I.spram_I[0]_ADDRESS_7_SB_LUT4_O": {
  157202. "hide_name": 0,
  157203. "type": "SB_LUT4",
  157204. "parameters": {
  157205. "LUT_INIT": "1111000011001100"
  157206. },
  157207. "attributes": {
  157208. "module_not_derived": "00000000000000000000000000000001",
  157209. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157210. },
  157211. "port_directions": {
  157212. "I0": "input",
  157213. "I1": "input",
  157214. "I2": "input",
  157215. "I3": "input",
  157216. "O": "output"
  157217. },
  157218. "connections": {
  157219. "I0": [ "0" ],
  157220. "I1": [ 693 ],
  157221. "I2": [ 6561 ],
  157222. "I3": [ 6551 ],
  157223. "O": [ 6537 ]
  157224. }
  157225. },
  157226. "vid_I.fb_I.spram_I[0]_ADDRESS_8_SB_LUT4_O": {
  157227. "hide_name": 0,
  157228. "type": "SB_LUT4",
  157229. "parameters": {
  157230. "LUT_INIT": "1111000011001100"
  157231. },
  157232. "attributes": {
  157233. "module_not_derived": "00000000000000000000000000000001",
  157234. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157235. },
  157236. "port_directions": {
  157237. "I0": "input",
  157238. "I1": "input",
  157239. "I2": "input",
  157240. "I3": "input",
  157241. "O": "output"
  157242. },
  157243. "connections": {
  157244. "I0": [ "0" ],
  157245. "I1": [ 695 ],
  157246. "I2": [ 6562 ],
  157247. "I3": [ 6551 ],
  157248. "O": [ 6536 ]
  157249. }
  157250. },
  157251. "vid_I.fb_I.spram_I[0]_ADDRESS_9_SB_LUT4_O": {
  157252. "hide_name": 0,
  157253. "type": "SB_LUT4",
  157254. "parameters": {
  157255. "LUT_INIT": "1111000011001100"
  157256. },
  157257. "attributes": {
  157258. "module_not_derived": "00000000000000000000000000000001",
  157259. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157260. },
  157261. "port_directions": {
  157262. "I0": "input",
  157263. "I1": "input",
  157264. "I2": "input",
  157265. "I3": "input",
  157266. "O": "output"
  157267. },
  157268. "connections": {
  157269. "I0": [ "0" ],
  157270. "I1": [ 697 ],
  157271. "I2": [ 6563 ],
  157272. "I3": [ 6551 ],
  157273. "O": [ 6535 ]
  157274. }
  157275. },
  157276. "vid_I.fb_I.spram_I[0]_ADDRESS_SB_LUT4_O": {
  157277. "hide_name": 0,
  157278. "type": "SB_LUT4",
  157279. "parameters": {
  157280. "LUT_INIT": "1111000011001100"
  157281. },
  157282. "attributes": {
  157283. "module_not_derived": "00000000000000000000000000000001",
  157284. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157285. },
  157286. "port_directions": {
  157287. "I0": "input",
  157288. "I1": "input",
  157289. "I2": "input",
  157290. "I3": "input",
  157291. "O": "output"
  157292. },
  157293. "connections": {
  157294. "I0": [ "0" ],
  157295. "I1": [ 685 ],
  157296. "I2": [ 6564 ],
  157297. "I3": [ 6551 ],
  157298. "O": [ 6544 ]
  157299. }
  157300. },
  157301. "vid_I.fb_I.spram_I[0]_MASKWREN_1_SB_LUT4_O": {
  157302. "hide_name": 0,
  157303. "type": "SB_LUT4",
  157304. "parameters": {
  157305. "LUT_INIT": "0011001100111111"
  157306. },
  157307. "attributes": {
  157308. "module_not_derived": "00000000000000000000000000000001",
  157309. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157310. },
  157311. "port_directions": {
  157312. "I0": "input",
  157313. "I1": "input",
  157314. "I2": "input",
  157315. "I3": "input",
  157316. "O": "output"
  157317. },
  157318. "connections": {
  157319. "I0": [ "0" ],
  157320. "I1": [ 469 ],
  157321. "I2": [ 3697 ],
  157322. "I3": [ 3698 ],
  157323. "O": [ 228 ]
  157324. }
  157325. },
  157326. "vid_I.fb_I.spram_I[0]_MASKWREN_SB_LUT4_O": {
  157327. "hide_name": 0,
  157328. "type": "SB_LUT4",
  157329. "parameters": {
  157330. "LUT_INIT": "1111111100001111"
  157331. },
  157332. "attributes": {
  157333. "module_not_derived": "00000000000000000000000000000001",
  157334. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  157335. },
  157336. "port_directions": {
  157337. "I0": "input",
  157338. "I1": "input",
  157339. "I2": "input",
  157340. "I3": "input",
  157341. "O": "output"
  157342. },
  157343. "connections": {
  157344. "I0": [ "0" ],
  157345. "I1": [ "0" ],
  157346. "I2": [ 469 ],
  157347. "I3": [ 6565 ],
  157348. "O": [ 227 ]
  157349. }
  157350. },
  157351. "vid_I.fb_I.spram_I[0]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_I3": {
  157352. "hide_name": 0,
  157353. "type": "SB_LUT4",
  157354. "parameters": {
  157355. "LUT_INIT": "0011111111111111"
  157356. },
  157357. "attributes": {
  157358. "module_not_derived": "00000000000000000000000000000001",
  157359. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157360. },
  157361. "port_directions": {
  157362. "I0": "input",
  157363. "I1": "input",
  157364. "I2": "input",
  157365. "I3": "input",
  157366. "O": "output"
  157367. },
  157368. "connections": {
  157369. "I0": [ "0" ],
  157370. "I1": [ 469 ],
  157371. "I2": [ 914 ],
  157372. "I3": [ 6565 ],
  157373. "O": [ 33 ]
  157374. }
  157375. },
  157376. "vid_I.fb_I.spram_I[0]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O": {
  157377. "hide_name": 0,
  157378. "type": "SB_LUT4",
  157379. "parameters": {
  157380. "LUT_INIT": "1111111111110111"
  157381. },
  157382. "attributes": {
  157383. "module_not_derived": "00000000000000000000000000000001",
  157384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  157385. },
  157386. "port_directions": {
  157387. "I0": "input",
  157388. "I1": "input",
  157389. "I2": "input",
  157390. "I3": "input",
  157391. "O": "output"
  157392. },
  157393. "connections": {
  157394. "I0": [ 469 ],
  157395. "I1": [ 914 ],
  157396. "I2": [ 3697 ],
  157397. "I3": [ 3698 ],
  157398. "O": [ 32 ]
  157399. }
  157400. },
  157401. "vid_I.fb_I.spram_I[0]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_O": {
  157402. "hide_name": 0,
  157403. "type": "SB_LUT4",
  157404. "parameters": {
  157405. "LUT_INIT": "0101010101010100"
  157406. },
  157407. "attributes": {
  157408. "module_not_derived": "00000000000000000000000000000001",
  157409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  157410. },
  157411. "port_directions": {
  157412. "I0": "input",
  157413. "I1": "input",
  157414. "I2": "input",
  157415. "I3": "input",
  157416. "O": "output"
  157417. },
  157418. "connections": {
  157419. "I0": [ 3697 ],
  157420. "I1": [ 3704 ],
  157421. "I2": [ 3705 ],
  157422. "I3": [ 3698 ],
  157423. "O": [ 6565 ]
  157424. }
  157425. },
  157426. "vid_I.fb_I.spram_I[0]_WREN_SB_LUT4_O": {
  157427. "hide_name": 0,
  157428. "type": "SB_LUT4",
  157429. "parameters": {
  157430. "LUT_INIT": "0000000011000000"
  157431. },
  157432. "attributes": {
  157433. "module_not_derived": "00000000000000000000000000000001",
  157434. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157435. },
  157436. "port_directions": {
  157437. "I0": "input",
  157438. "I1": "input",
  157439. "I2": "input",
  157440. "I3": "input",
  157441. "O": "output"
  157442. },
  157443. "connections": {
  157444. "I0": [ "0" ],
  157445. "I1": [ 718 ],
  157446. "I2": [ 6566 ],
  157447. "I3": [ 6551 ],
  157448. "O": [ 6549 ]
  157449. }
  157450. },
  157451. "vid_I.fb_I.spram_I[1]": {
  157452. "hide_name": 0,
  157453. "type": "SB_SPRAM256KA",
  157454. "parameters": {
  157455. },
  157456. "attributes": {
  157457. "hdlname": "vid_I fb_I spram_I[1]",
  157458. "module_not_derived": "00000000000000000000000000000001",
  157459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:45.16-56.3"
  157460. },
  157461. "port_directions": {
  157462. "ADDRESS": "input",
  157463. "CHIPSELECT": "input",
  157464. "CLOCK": "input",
  157465. "DATAIN": "input",
  157466. "DATAOUT": "output",
  157467. "MASKWREN": "input",
  157468. "POWEROFF": "input",
  157469. "SLEEP": "input",
  157470. "STANDBY": "input",
  157471. "WREN": "input"
  157472. },
  157473. "connections": {
  157474. "ADDRESS": [ 6531, 6532, 6533, 6534, 6535, 6536, 6537, 6538, 6539, 6540, 6541, 6542, 6543, 6544 ],
  157475. "CHIPSELECT": [ "1" ],
  157476. "CLOCK": [ 42 ],
  157477. "DATAIN": [ 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  157478. "DATAOUT": [ 6567, 6568, 6569, 6570, 6571, 6572, 6573, 6574, 6575, 6576, 6577, 6578, 6485, 6486, 6487, 6488 ],
  157479. "MASKWREN": [ 226, 226, 229, 229 ],
  157480. "POWEROFF": [ "1" ],
  157481. "SLEEP": [ "0" ],
  157482. "STANDBY": [ "0" ],
  157483. "WREN": [ 6549 ]
  157484. }
  157485. },
  157486. "vid_I.fb_I.spram_I[1]_MASKWREN_1_SB_LUT4_O": {
  157487. "hide_name": 0,
  157488. "type": "SB_LUT4",
  157489. "parameters": {
  157490. "LUT_INIT": "1111111100001111"
  157491. },
  157492. "attributes": {
  157493. "module_not_derived": "00000000000000000000000000000001",
  157494. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  157495. },
  157496. "port_directions": {
  157497. "I0": "input",
  157498. "I1": "input",
  157499. "I2": "input",
  157500. "I3": "input",
  157501. "O": "output"
  157502. },
  157503. "connections": {
  157504. "I0": [ "0" ],
  157505. "I1": [ "0" ],
  157506. "I2": [ 469 ],
  157507. "I3": [ 6579 ],
  157508. "O": [ 226 ]
  157509. }
  157510. },
  157511. "vid_I.fb_I.spram_I[1]_MASKWREN_1_SB_LUT4_O_I3_SB_LUT4_I3": {
  157512. "hide_name": 0,
  157513. "type": "SB_LUT4",
  157514. "parameters": {
  157515. "LUT_INIT": "0011111111111111"
  157516. },
  157517. "attributes": {
  157518. "module_not_derived": "00000000000000000000000000000001",
  157519. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157520. },
  157521. "port_directions": {
  157522. "I0": "input",
  157523. "I1": "input",
  157524. "I2": "input",
  157525. "I3": "input",
  157526. "O": "output"
  157527. },
  157528. "connections": {
  157529. "I0": [ "0" ],
  157530. "I1": [ 469 ],
  157531. "I2": [ 914 ],
  157532. "I3": [ 6579 ],
  157533. "O": [ 76 ]
  157534. }
  157535. },
  157536. "vid_I.fb_I.spram_I[1]_MASKWREN_1_SB_LUT4_O_I3_SB_LUT4_O": {
  157537. "hide_name": 0,
  157538. "type": "SB_LUT4",
  157539. "parameters": {
  157540. "LUT_INIT": "0101010011101110"
  157541. },
  157542. "attributes": {
  157543. "module_not_derived": "00000000000000000000000000000001",
  157544. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  157545. },
  157546. "port_directions": {
  157547. "I0": "input",
  157548. "I1": "input",
  157549. "I2": "input",
  157550. "I3": "input",
  157551. "O": "output"
  157552. },
  157553. "connections": {
  157554. "I0": [ 3697 ],
  157555. "I1": [ 3704 ],
  157556. "I2": [ 3705 ],
  157557. "I3": [ 3698 ],
  157558. "O": [ 6579 ]
  157559. }
  157560. },
  157561. "vid_I.fb_I.spram_I[1]_MASKWREN_SB_LUT4_O": {
  157562. "hide_name": 0,
  157563. "type": "SB_LUT4",
  157564. "parameters": {
  157565. "LUT_INIT": "1111111100001111"
  157566. },
  157567. "attributes": {
  157568. "module_not_derived": "00000000000000000000000000000001",
  157569. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  157570. },
  157571. "port_directions": {
  157572. "I0": "input",
  157573. "I1": "input",
  157574. "I2": "input",
  157575. "I3": "input",
  157576. "O": "output"
  157577. },
  157578. "connections": {
  157579. "I0": [ "0" ],
  157580. "I1": [ "0" ],
  157581. "I2": [ 469 ],
  157582. "I3": [ 6580 ],
  157583. "O": [ 229 ]
  157584. }
  157585. },
  157586. "vid_I.fb_I.spram_I[1]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_I3": {
  157587. "hide_name": 0,
  157588. "type": "SB_LUT4",
  157589. "parameters": {
  157590. "LUT_INIT": "0011111111111111"
  157591. },
  157592. "attributes": {
  157593. "module_not_derived": "00000000000000000000000000000001",
  157594. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157595. },
  157596. "port_directions": {
  157597. "I0": "input",
  157598. "I1": "input",
  157599. "I2": "input",
  157600. "I3": "input",
  157601. "O": "output"
  157602. },
  157603. "connections": {
  157604. "I0": [ "0" ],
  157605. "I1": [ 469 ],
  157606. "I2": [ 914 ],
  157607. "I3": [ 6580 ],
  157608. "O": [ 77 ]
  157609. }
  157610. },
  157611. "vid_I.fb_I.spram_I[1]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_O": {
  157612. "hide_name": 0,
  157613. "type": "SB_LUT4",
  157614. "parameters": {
  157615. "LUT_INIT": "1110111011101100"
  157616. },
  157617. "attributes": {
  157618. "module_not_derived": "00000000000000000000000000000001",
  157619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  157620. },
  157621. "port_directions": {
  157622. "I0": "input",
  157623. "I1": "input",
  157624. "I2": "input",
  157625. "I3": "input",
  157626. "O": "output"
  157627. },
  157628. "connections": {
  157629. "I0": [ 3697 ],
  157630. "I1": [ 3704 ],
  157631. "I2": [ 3705 ],
  157632. "I3": [ 3698 ],
  157633. "O": [ 6580 ]
  157634. }
  157635. },
  157636. "vid_I.fb_I.v_re_0_SB_LUT4_O": {
  157637. "hide_name": 0,
  157638. "type": "SB_LUT4",
  157639. "parameters": {
  157640. "LUT_INIT": "0000000000000100"
  157641. },
  157642. "attributes": {
  157643. "module_not_derived": "00000000000000000000000000000001",
  157644. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  157645. },
  157646. "port_directions": {
  157647. "I0": "input",
  157648. "I1": "input",
  157649. "I2": "input",
  157650. "I3": "input",
  157651. "O": "output"
  157652. },
  157653. "connections": {
  157654. "I0": [ 6581 ],
  157655. "I1": [ 6513 ],
  157656. "I2": [ 6582 ],
  157657. "I3": [ 6583 ],
  157658. "O": [ 6551 ]
  157659. }
  157660. },
  157661. "vid_I.pal_I.ebr_I": {
  157662. "hide_name": 0,
  157663. "type": "SB_RAM40_4K",
  157664. "parameters": {
  157665. "READ_MODE": "00000000000000000000000000000000",
  157666. "WRITE_MODE": "00000000000000000000000000000000"
  157667. },
  157668. "attributes": {
  157669. "hdlname": "vid_I pal_I ebr_I",
  157670. "module_not_derived": "00000000000000000000000000000001",
  157671. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:31.4-43.3"
  157672. },
  157673. "port_directions": {
  157674. "MASK": "input",
  157675. "RADDR": "input",
  157676. "RCLK": "input",
  157677. "RCLKE": "input",
  157678. "RDATA": "output",
  157679. "RE": "input",
  157680. "WADDR": "input",
  157681. "WCLK": "input",
  157682. "WCLKE": "input",
  157683. "WDATA": "input",
  157684. "WE": "input"
  157685. },
  157686. "connections": {
  157687. "MASK": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  157688. "RADDR": [ 6584, 6585, 6586, 6587, 6588, 6589, 6590, 6591, "0", "0", "0" ],
  157689. "RCLK": [ 42 ],
  157690. "RCLKE": [ "1" ],
  157691. "RDATA": [ 6592, 6593, 6594, 6595, 6596, 6597, 6598, 6599, 6600, 6601, 6602, 6603, 6604, 6605, 6606, 6607 ],
  157692. "RE": [ "1" ],
  157693. "WADDR": [ 706, 704, 701, 699, 697, 695, 693, 691, "0", "0", "0" ],
  157694. "WCLK": [ 42 ],
  157695. "WCLKE": [ 6608 ],
  157696. "WDATA": [ 72, 62, 70, 66, 74, 65, 73, 63, 71, 67, 75, 107, 97, 105, 101, 109 ],
  157697. "WE": [ "1" ]
  157698. }
  157699. },
  157700. "vid_I.pal_I.ebr_I_WCLKE_SB_LUT4_O": {
  157701. "hide_name": 0,
  157702. "type": "SB_LUT4",
  157703. "parameters": {
  157704. "LUT_INIT": "0011000000000000"
  157705. },
  157706. "attributes": {
  157707. "module_not_derived": "00000000000000000000000000000001",
  157708. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  157709. },
  157710. "port_directions": {
  157711. "I0": "input",
  157712. "I1": "input",
  157713. "I2": "input",
  157714. "I3": "input",
  157715. "O": "output"
  157716. },
  157717. "connections": {
  157718. "I0": [ "0" ],
  157719. "I1": [ 718 ],
  157720. "I2": [ 708 ],
  157721. "I3": [ 6566 ],
  157722. "O": [ 6608 ]
  157723. }
  157724. },
  157725. "vid_I.phy_I.iob_hdmi_clk_I": {
  157726. "hide_name": 0,
  157727. "type": "SB_IO",
  157728. "parameters": {
  157729. "IO_STANDARD": "SB_LVCMOS",
  157730. "NEG_TRIGGER": "0",
  157731. "PIN_TYPE": "010011",
  157732. "PULLUP": "0"
  157733. },
  157734. "attributes": {
  157735. "hdlname": "vid_I phy_I iob_hdmi_clk_I",
  157736. "module_not_derived": "00000000000000000000000000000001",
  157737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:88.4-93.3"
  157738. },
  157739. "port_directions": {
  157740. "CLOCK_ENABLE": "input",
  157741. "D_OUT_0": "input",
  157742. "D_OUT_1": "input",
  157743. "OUTPUT_CLK": "input",
  157744. "PACKAGE_PIN": "inout"
  157745. },
  157746. "connections": {
  157747. "CLOCK_ENABLE": [ "1" ],
  157748. "D_OUT_0": [ "0" ],
  157749. "D_OUT_1": [ "1" ],
  157750. "OUTPUT_CLK": [ 42 ],
  157751. "PACKAGE_PIN": [ 24 ]
  157752. }
  157753. },
  157754. "vid_I.phy_I.iob_hdmi_ctrl_I[0]": {
  157755. "hide_name": 0,
  157756. "type": "SB_IO",
  157757. "parameters": {
  157758. "IO_STANDARD": "SB_LVCMOS",
  157759. "NEG_TRIGGER": "0",
  157760. "PIN_TYPE": "010111",
  157761. "PULLUP": "0"
  157762. },
  157763. "attributes": {
  157764. "hdlname": "vid_I phy_I iob_hdmi_ctrl_I[0]",
  157765. "module_not_derived": "00000000000000000000000000000001",
  157766. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:76.4-80.3"
  157767. },
  157768. "port_directions": {
  157769. "CLOCK_ENABLE": "input",
  157770. "D_OUT_0": "input",
  157771. "OUTPUT_CLK": "input",
  157772. "PACKAGE_PIN": "inout"
  157773. },
  157774. "connections": {
  157775. "CLOCK_ENABLE": [ "1" ],
  157776. "D_OUT_0": [ 6514 ],
  157777. "OUTPUT_CLK": [ 42 ],
  157778. "PACKAGE_PIN": [ 23 ]
  157779. }
  157780. },
  157781. "vid_I.phy_I.iob_hdmi_ctrl_I[1]": {
  157782. "hide_name": 0,
  157783. "type": "SB_IO",
  157784. "parameters": {
  157785. "IO_STANDARD": "SB_LVCMOS",
  157786. "NEG_TRIGGER": "0",
  157787. "PIN_TYPE": "010111",
  157788. "PULLUP": "0"
  157789. },
  157790. "attributes": {
  157791. "hdlname": "vid_I phy_I iob_hdmi_ctrl_I[1]",
  157792. "module_not_derived": "00000000000000000000000000000001",
  157793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:76.4-80.3"
  157794. },
  157795. "port_directions": {
  157796. "CLOCK_ENABLE": "input",
  157797. "D_OUT_0": "input",
  157798. "OUTPUT_CLK": "input",
  157799. "PACKAGE_PIN": "inout"
  157800. },
  157801. "connections": {
  157802. "CLOCK_ENABLE": [ "1" ],
  157803. "D_OUT_0": [ 6530 ],
  157804. "OUTPUT_CLK": [ 42 ],
  157805. "PACKAGE_PIN": [ 22 ]
  157806. }
  157807. },
  157808. "vid_I.phy_I.iob_hdmi_ctrl_I[2]": {
  157809. "hide_name": 0,
  157810. "type": "SB_IO",
  157811. "parameters": {
  157812. "IO_STANDARD": "SB_LVCMOS",
  157813. "NEG_TRIGGER": "0",
  157814. "PIN_TYPE": "010111",
  157815. "PULLUP": "0"
  157816. },
  157817. "attributes": {
  157818. "hdlname": "vid_I phy_I iob_hdmi_ctrl_I[2]",
  157819. "module_not_derived": "00000000000000000000000000000001",
  157820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:76.4-80.3"
  157821. },
  157822. "port_directions": {
  157823. "CLOCK_ENABLE": "input",
  157824. "D_OUT_0": "input",
  157825. "OUTPUT_CLK": "input",
  157826. "PACKAGE_PIN": "inout"
  157827. },
  157828. "connections": {
  157829. "CLOCK_ENABLE": [ "1" ],
  157830. "D_OUT_0": [ 6523 ],
  157831. "OUTPUT_CLK": [ 42 ],
  157832. "PACKAGE_PIN": [ 21 ]
  157833. }
  157834. },
  157835. "vid_I.phy_I.iob_hdmi_data_I[0]": {
  157836. "hide_name": 0,
  157837. "type": "SB_IO",
  157838. "parameters": {
  157839. "IO_STANDARD": "SB_LVCMOS",
  157840. "NEG_TRIGGER": "0",
  157841. "PIN_TYPE": "010111",
  157842. "PULLUP": "0"
  157843. },
  157844. "attributes": {
  157845. "hdlname": "vid_I phy_I iob_hdmi_data_I[0]",
  157846. "module_not_derived": "00000000000000000000000000000001",
  157847. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  157848. },
  157849. "port_directions": {
  157850. "CLOCK_ENABLE": "input",
  157851. "D_OUT_0": "input",
  157852. "OUTPUT_CLK": "input",
  157853. "PACKAGE_PIN": "inout"
  157854. },
  157855. "connections": {
  157856. "CLOCK_ENABLE": [ "1" ],
  157857. "D_OUT_0": [ 6593 ],
  157858. "OUTPUT_CLK": [ 42 ],
  157859. "PACKAGE_PIN": [ 17 ]
  157860. }
  157861. },
  157862. "vid_I.phy_I.iob_hdmi_data_I[10]": {
  157863. "hide_name": 0,
  157864. "type": "SB_IO",
  157865. "parameters": {
  157866. "IO_STANDARD": "SB_LVCMOS",
  157867. "NEG_TRIGGER": "0",
  157868. "PIN_TYPE": "010111",
  157869. "PULLUP": "0"
  157870. },
  157871. "attributes": {
  157872. "hdlname": "vid_I phy_I iob_hdmi_data_I[10]",
  157873. "module_not_derived": "00000000000000000000000000000001",
  157874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  157875. },
  157876. "port_directions": {
  157877. "CLOCK_ENABLE": "input",
  157878. "D_OUT_0": "input",
  157879. "OUTPUT_CLK": "input",
  157880. "PACKAGE_PIN": "inout"
  157881. },
  157882. "connections": {
  157883. "CLOCK_ENABLE": [ "1" ],
  157884. "D_OUT_0": [ 6606 ],
  157885. "OUTPUT_CLK": [ 42 ],
  157886. "PACKAGE_PIN": [ 11 ]
  157887. }
  157888. },
  157889. "vid_I.phy_I.iob_hdmi_data_I[11]": {
  157890. "hide_name": 0,
  157891. "type": "SB_IO",
  157892. "parameters": {
  157893. "IO_STANDARD": "SB_LVCMOS",
  157894. "NEG_TRIGGER": "0",
  157895. "PIN_TYPE": "010111",
  157896. "PULLUP": "0"
  157897. },
  157898. "attributes": {
  157899. "hdlname": "vid_I phy_I iob_hdmi_data_I[11]",
  157900. "module_not_derived": "00000000000000000000000000000001",
  157901. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  157902. },
  157903. "port_directions": {
  157904. "CLOCK_ENABLE": "input",
  157905. "D_OUT_0": "input",
  157906. "OUTPUT_CLK": "input",
  157907. "PACKAGE_PIN": "inout"
  157908. },
  157909. "connections": {
  157910. "CLOCK_ENABLE": [ "1" ],
  157911. "D_OUT_0": [ 6607 ],
  157912. "OUTPUT_CLK": [ 42 ],
  157913. "PACKAGE_PIN": [ 12 ]
  157914. }
  157915. },
  157916. "vid_I.phy_I.iob_hdmi_data_I[1]": {
  157917. "hide_name": 0,
  157918. "type": "SB_IO",
  157919. "parameters": {
  157920. "IO_STANDARD": "SB_LVCMOS",
  157921. "NEG_TRIGGER": "0",
  157922. "PIN_TYPE": "010111",
  157923. "PULLUP": "0"
  157924. },
  157925. "attributes": {
  157926. "hdlname": "vid_I phy_I iob_hdmi_data_I[1]",
  157927. "module_not_derived": "00000000000000000000000000000001",
  157928. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  157929. },
  157930. "port_directions": {
  157931. "CLOCK_ENABLE": "input",
  157932. "D_OUT_0": "input",
  157933. "OUTPUT_CLK": "input",
  157934. "PACKAGE_PIN": "inout"
  157935. },
  157936. "connections": {
  157937. "CLOCK_ENABLE": [ "1" ],
  157938. "D_OUT_0": [ 6594 ],
  157939. "OUTPUT_CLK": [ 42 ],
  157940. "PACKAGE_PIN": [ 18 ]
  157941. }
  157942. },
  157943. "vid_I.phy_I.iob_hdmi_data_I[2]": {
  157944. "hide_name": 0,
  157945. "type": "SB_IO",
  157946. "parameters": {
  157947. "IO_STANDARD": "SB_LVCMOS",
  157948. "NEG_TRIGGER": "0",
  157949. "PIN_TYPE": "010111",
  157950. "PULLUP": "0"
  157951. },
  157952. "attributes": {
  157953. "hdlname": "vid_I phy_I iob_hdmi_data_I[2]",
  157954. "module_not_derived": "00000000000000000000000000000001",
  157955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  157956. },
  157957. "port_directions": {
  157958. "CLOCK_ENABLE": "input",
  157959. "D_OUT_0": "input",
  157960. "OUTPUT_CLK": "input",
  157961. "PACKAGE_PIN": "inout"
  157962. },
  157963. "connections": {
  157964. "CLOCK_ENABLE": [ "1" ],
  157965. "D_OUT_0": [ 6595 ],
  157966. "OUTPUT_CLK": [ 42 ],
  157967. "PACKAGE_PIN": [ 19 ]
  157968. }
  157969. },
  157970. "vid_I.phy_I.iob_hdmi_data_I[3]": {
  157971. "hide_name": 0,
  157972. "type": "SB_IO",
  157973. "parameters": {
  157974. "IO_STANDARD": "SB_LVCMOS",
  157975. "NEG_TRIGGER": "0",
  157976. "PIN_TYPE": "010111",
  157977. "PULLUP": "0"
  157978. },
  157979. "attributes": {
  157980. "hdlname": "vid_I phy_I iob_hdmi_data_I[3]",
  157981. "module_not_derived": "00000000000000000000000000000001",
  157982. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  157983. },
  157984. "port_directions": {
  157985. "CLOCK_ENABLE": "input",
  157986. "D_OUT_0": "input",
  157987. "OUTPUT_CLK": "input",
  157988. "PACKAGE_PIN": "inout"
  157989. },
  157990. "connections": {
  157991. "CLOCK_ENABLE": [ "1" ],
  157992. "D_OUT_0": [ 6596 ],
  157993. "OUTPUT_CLK": [ 42 ],
  157994. "PACKAGE_PIN": [ 20 ]
  157995. }
  157996. },
  157997. "vid_I.phy_I.iob_hdmi_data_I[4]": {
  157998. "hide_name": 0,
  157999. "type": "SB_IO",
  158000. "parameters": {
  158001. "IO_STANDARD": "SB_LVCMOS",
  158002. "NEG_TRIGGER": "0",
  158003. "PIN_TYPE": "010111",
  158004. "PULLUP": "0"
  158005. },
  158006. "attributes": {
  158007. "hdlname": "vid_I phy_I iob_hdmi_data_I[4]",
  158008. "module_not_derived": "00000000000000000000000000000001",
  158009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  158010. },
  158011. "port_directions": {
  158012. "CLOCK_ENABLE": "input",
  158013. "D_OUT_0": "input",
  158014. "OUTPUT_CLK": "input",
  158015. "PACKAGE_PIN": "inout"
  158016. },
  158017. "connections": {
  158018. "CLOCK_ENABLE": [ "1" ],
  158019. "D_OUT_0": [ 6599 ],
  158020. "OUTPUT_CLK": [ 42 ],
  158021. "PACKAGE_PIN": [ 13 ]
  158022. }
  158023. },
  158024. "vid_I.phy_I.iob_hdmi_data_I[5]": {
  158025. "hide_name": 0,
  158026. "type": "SB_IO",
  158027. "parameters": {
  158028. "IO_STANDARD": "SB_LVCMOS",
  158029. "NEG_TRIGGER": "0",
  158030. "PIN_TYPE": "010111",
  158031. "PULLUP": "0"
  158032. },
  158033. "attributes": {
  158034. "hdlname": "vid_I phy_I iob_hdmi_data_I[5]",
  158035. "module_not_derived": "00000000000000000000000000000001",
  158036. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  158037. },
  158038. "port_directions": {
  158039. "CLOCK_ENABLE": "input",
  158040. "D_OUT_0": "input",
  158041. "OUTPUT_CLK": "input",
  158042. "PACKAGE_PIN": "inout"
  158043. },
  158044. "connections": {
  158045. "CLOCK_ENABLE": [ "1" ],
  158046. "D_OUT_0": [ 6600 ],
  158047. "OUTPUT_CLK": [ 42 ],
  158048. "PACKAGE_PIN": [ 14 ]
  158049. }
  158050. },
  158051. "vid_I.phy_I.iob_hdmi_data_I[6]": {
  158052. "hide_name": 0,
  158053. "type": "SB_IO",
  158054. "parameters": {
  158055. "IO_STANDARD": "SB_LVCMOS",
  158056. "NEG_TRIGGER": "0",
  158057. "PIN_TYPE": "010111",
  158058. "PULLUP": "0"
  158059. },
  158060. "attributes": {
  158061. "hdlname": "vid_I phy_I iob_hdmi_data_I[6]",
  158062. "module_not_derived": "00000000000000000000000000000001",
  158063. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  158064. },
  158065. "port_directions": {
  158066. "CLOCK_ENABLE": "input",
  158067. "D_OUT_0": "input",
  158068. "OUTPUT_CLK": "input",
  158069. "PACKAGE_PIN": "inout"
  158070. },
  158071. "connections": {
  158072. "CLOCK_ENABLE": [ "1" ],
  158073. "D_OUT_0": [ 6601 ],
  158074. "OUTPUT_CLK": [ 42 ],
  158075. "PACKAGE_PIN": [ 15 ]
  158076. }
  158077. },
  158078. "vid_I.phy_I.iob_hdmi_data_I[7]": {
  158079. "hide_name": 0,
  158080. "type": "SB_IO",
  158081. "parameters": {
  158082. "IO_STANDARD": "SB_LVCMOS",
  158083. "NEG_TRIGGER": "0",
  158084. "PIN_TYPE": "010111",
  158085. "PULLUP": "0"
  158086. },
  158087. "attributes": {
  158088. "hdlname": "vid_I phy_I iob_hdmi_data_I[7]",
  158089. "module_not_derived": "00000000000000000000000000000001",
  158090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  158091. },
  158092. "port_directions": {
  158093. "CLOCK_ENABLE": "input",
  158094. "D_OUT_0": "input",
  158095. "OUTPUT_CLK": "input",
  158096. "PACKAGE_PIN": "inout"
  158097. },
  158098. "connections": {
  158099. "CLOCK_ENABLE": [ "1" ],
  158100. "D_OUT_0": [ 6602 ],
  158101. "OUTPUT_CLK": [ 42 ],
  158102. "PACKAGE_PIN": [ 16 ]
  158103. }
  158104. },
  158105. "vid_I.phy_I.iob_hdmi_data_I[8]": {
  158106. "hide_name": 0,
  158107. "type": "SB_IO",
  158108. "parameters": {
  158109. "IO_STANDARD": "SB_LVCMOS",
  158110. "NEG_TRIGGER": "0",
  158111. "PIN_TYPE": "010111",
  158112. "PULLUP": "0"
  158113. },
  158114. "attributes": {
  158115. "hdlname": "vid_I phy_I iob_hdmi_data_I[8]",
  158116. "module_not_derived": "00000000000000000000000000000001",
  158117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  158118. },
  158119. "port_directions": {
  158120. "CLOCK_ENABLE": "input",
  158121. "D_OUT_0": "input",
  158122. "OUTPUT_CLK": "input",
  158123. "PACKAGE_PIN": "inout"
  158124. },
  158125. "connections": {
  158126. "CLOCK_ENABLE": [ "1" ],
  158127. "D_OUT_0": [ 6604 ],
  158128. "OUTPUT_CLK": [ 42 ],
  158129. "PACKAGE_PIN": [ 9 ]
  158130. }
  158131. },
  158132. "vid_I.phy_I.iob_hdmi_data_I[9]": {
  158133. "hide_name": 0,
  158134. "type": "SB_IO",
  158135. "parameters": {
  158136. "IO_STANDARD": "SB_LVCMOS",
  158137. "NEG_TRIGGER": "0",
  158138. "PIN_TYPE": "010111",
  158139. "PULLUP": "0"
  158140. },
  158141. "attributes": {
  158142. "hdlname": "vid_I phy_I iob_hdmi_data_I[9]",
  158143. "module_not_derived": "00000000000000000000000000000001",
  158144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:64.4-68.3"
  158145. },
  158146. "port_directions": {
  158147. "CLOCK_ENABLE": "input",
  158148. "D_OUT_0": "input",
  158149. "OUTPUT_CLK": "input",
  158150. "PACKAGE_PIN": "inout"
  158151. },
  158152. "connections": {
  158153. "CLOCK_ENABLE": [ "1" ],
  158154. "D_OUT_0": [ 6605 ],
  158155. "OUTPUT_CLK": [ 42 ],
  158156. "PACKAGE_PIN": [ 10 ]
  158157. }
  158158. },
  158159. "vid_I.pp_active_1_SB_DFF_Q": {
  158160. "hide_name": 0,
  158161. "type": "SB_DFF",
  158162. "parameters": {
  158163. },
  158164. "attributes": {
  158165. "module_not_derived": "00000000000000000000000000000001",
  158166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:30.4-31.32|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  158167. },
  158168. "port_directions": {
  158169. "C": "input",
  158170. "D": "input",
  158171. "Q": "output"
  158172. },
  158173. "connections": {
  158174. "C": [ 42 ],
  158175. "D": [ 6609 ],
  158176. "Q": [ 6513 ]
  158177. }
  158178. },
  158179. "vid_I.pp_addr_base_1_SB_DFFESR_Q": {
  158180. "hide_name": 0,
  158181. "type": "SB_DFFESR",
  158182. "parameters": {
  158183. },
  158184. "attributes": {
  158185. "module_not_derived": "00000000000000000000000000000001",
  158186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158187. },
  158188. "port_directions": {
  158189. "C": "input",
  158190. "D": "input",
  158191. "E": "input",
  158192. "Q": "output",
  158193. "R": "input"
  158194. },
  158195. "connections": {
  158196. "C": [ 42 ],
  158197. "D": [ 6610 ],
  158198. "E": [ 6611 ],
  158199. "Q": [ 6612 ],
  158200. "R": [ 6613 ]
  158201. }
  158202. },
  158203. "vid_I.pp_addr_base_1_SB_DFFESR_Q_1": {
  158204. "hide_name": 0,
  158205. "type": "SB_DFFESR",
  158206. "parameters": {
  158207. },
  158208. "attributes": {
  158209. "module_not_derived": "00000000000000000000000000000001",
  158210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158211. },
  158212. "port_directions": {
  158213. "C": "input",
  158214. "D": "input",
  158215. "E": "input",
  158216. "Q": "output",
  158217. "R": "input"
  158218. },
  158219. "connections": {
  158220. "C": [ 42 ],
  158221. "D": [ 6614 ],
  158222. "E": [ 6611 ],
  158223. "Q": [ 6615 ],
  158224. "R": [ 6613 ]
  158225. }
  158226. },
  158227. "vid_I.pp_addr_base_1_SB_DFFESR_Q_2": {
  158228. "hide_name": 0,
  158229. "type": "SB_DFFESR",
  158230. "parameters": {
  158231. },
  158232. "attributes": {
  158233. "module_not_derived": "00000000000000000000000000000001",
  158234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158235. },
  158236. "port_directions": {
  158237. "C": "input",
  158238. "D": "input",
  158239. "E": "input",
  158240. "Q": "output",
  158241. "R": "input"
  158242. },
  158243. "connections": {
  158244. "C": [ 42 ],
  158245. "D": [ 6616 ],
  158246. "E": [ 6611 ],
  158247. "Q": [ 6617 ],
  158248. "R": [ 6613 ]
  158249. }
  158250. },
  158251. "vid_I.pp_addr_base_1_SB_DFFESR_Q_3": {
  158252. "hide_name": 0,
  158253. "type": "SB_DFFESR",
  158254. "parameters": {
  158255. },
  158256. "attributes": {
  158257. "module_not_derived": "00000000000000000000000000000001",
  158258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158259. },
  158260. "port_directions": {
  158261. "C": "input",
  158262. "D": "input",
  158263. "E": "input",
  158264. "Q": "output",
  158265. "R": "input"
  158266. },
  158267. "connections": {
  158268. "C": [ 42 ],
  158269. "D": [ 6618 ],
  158270. "E": [ 6611 ],
  158271. "Q": [ 6619 ],
  158272. "R": [ 6613 ]
  158273. }
  158274. },
  158275. "vid_I.pp_addr_base_1_SB_DFFESR_Q_4": {
  158276. "hide_name": 0,
  158277. "type": "SB_DFFESR",
  158278. "parameters": {
  158279. },
  158280. "attributes": {
  158281. "module_not_derived": "00000000000000000000000000000001",
  158282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158283. },
  158284. "port_directions": {
  158285. "C": "input",
  158286. "D": "input",
  158287. "E": "input",
  158288. "Q": "output",
  158289. "R": "input"
  158290. },
  158291. "connections": {
  158292. "C": [ 42 ],
  158293. "D": [ 6620 ],
  158294. "E": [ 6611 ],
  158295. "Q": [ 6621 ],
  158296. "R": [ 6613 ]
  158297. }
  158298. },
  158299. "vid_I.pp_addr_base_1_SB_DFFESR_Q_5": {
  158300. "hide_name": 0,
  158301. "type": "SB_DFFESR",
  158302. "parameters": {
  158303. },
  158304. "attributes": {
  158305. "module_not_derived": "00000000000000000000000000000001",
  158306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158307. },
  158308. "port_directions": {
  158309. "C": "input",
  158310. "D": "input",
  158311. "E": "input",
  158312. "Q": "output",
  158313. "R": "input"
  158314. },
  158315. "connections": {
  158316. "C": [ 42 ],
  158317. "D": [ 6622 ],
  158318. "E": [ 6611 ],
  158319. "Q": [ 6623 ],
  158320. "R": [ 6613 ]
  158321. }
  158322. },
  158323. "vid_I.pp_addr_base_1_SB_DFFESR_Q_6": {
  158324. "hide_name": 0,
  158325. "type": "SB_DFFESR",
  158326. "parameters": {
  158327. },
  158328. "attributes": {
  158329. "module_not_derived": "00000000000000000000000000000001",
  158330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158331. },
  158332. "port_directions": {
  158333. "C": "input",
  158334. "D": "input",
  158335. "E": "input",
  158336. "Q": "output",
  158337. "R": "input"
  158338. },
  158339. "connections": {
  158340. "C": [ 42 ],
  158341. "D": [ 6624 ],
  158342. "E": [ 6611 ],
  158343. "Q": [ 6625 ],
  158344. "R": [ 6613 ]
  158345. }
  158346. },
  158347. "vid_I.pp_addr_base_1_SB_DFFESR_Q_7": {
  158348. "hide_name": 0,
  158349. "type": "SB_DFFESR",
  158350. "parameters": {
  158351. },
  158352. "attributes": {
  158353. "module_not_derived": "00000000000000000000000000000001",
  158354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158355. },
  158356. "port_directions": {
  158357. "C": "input",
  158358. "D": "input",
  158359. "E": "input",
  158360. "Q": "output",
  158361. "R": "input"
  158362. },
  158363. "connections": {
  158364. "C": [ 42 ],
  158365. "D": [ 6626 ],
  158366. "E": [ 6611 ],
  158367. "Q": [ 6627 ],
  158368. "R": [ 6613 ]
  158369. }
  158370. },
  158371. "vid_I.pp_addr_base_1_SB_DFFESR_Q_8": {
  158372. "hide_name": 0,
  158373. "type": "SB_DFFESR",
  158374. "parameters": {
  158375. },
  158376. "attributes": {
  158377. "module_not_derived": "00000000000000000000000000000001",
  158378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158379. },
  158380. "port_directions": {
  158381. "C": "input",
  158382. "D": "input",
  158383. "E": "input",
  158384. "Q": "output",
  158385. "R": "input"
  158386. },
  158387. "connections": {
  158388. "C": [ 42 ],
  158389. "D": [ 6628 ],
  158390. "E": [ 6611 ],
  158391. "Q": [ 6629 ],
  158392. "R": [ 6613 ]
  158393. }
  158394. },
  158395. "vid_I.pp_addr_base_1_SB_DFFESR_Q_9": {
  158396. "hide_name": 0,
  158397. "type": "SB_DFFESR",
  158398. "parameters": {
  158399. },
  158400. "attributes": {
  158401. "module_not_derived": "00000000000000000000000000000001",
  158402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:231.2-237.6|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  158403. },
  158404. "port_directions": {
  158405. "C": "input",
  158406. "D": "input",
  158407. "E": "input",
  158408. "Q": "output",
  158409. "R": "input"
  158410. },
  158411. "connections": {
  158412. "C": [ 42 ],
  158413. "D": [ 6630 ],
  158414. "E": [ 6611 ],
  158415. "Q": [ 6631 ],
  158416. "R": [ 6613 ]
  158417. }
  158418. },
  158419. "vid_I.pp_addr_cur_1_SB_DFFSR_Q": {
  158420. "hide_name": 0,
  158421. "type": "SB_DFFSR",
  158422. "parameters": {
  158423. },
  158424. "attributes": {
  158425. "module_not_derived": "00000000000000000000000000000001",
  158426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  158427. },
  158428. "port_directions": {
  158429. "C": "input",
  158430. "D": "input",
  158431. "Q": "output",
  158432. "R": "input"
  158433. },
  158434. "connections": {
  158435. "C": [ 42 ],
  158436. "D": [ 6632 ],
  158437. "Q": [ 6583 ],
  158438. "R": [ 6611 ]
  158439. }
  158440. },
  158441. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_1": {
  158442. "hide_name": 0,
  158443. "type": "SB_DFFSR",
  158444. "parameters": {
  158445. },
  158446. "attributes": {
  158447. "module_not_derived": "00000000000000000000000000000001",
  158448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  158449. },
  158450. "port_directions": {
  158451. "C": "input",
  158452. "D": "input",
  158453. "Q": "output",
  158454. "R": "input"
  158455. },
  158456. "connections": {
  158457. "C": [ 42 ],
  158458. "D": [ 6633 ],
  158459. "Q": [ 6581 ],
  158460. "R": [ 6611 ]
  158461. }
  158462. },
  158463. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_2": {
  158464. "hide_name": 0,
  158465. "type": "SB_DFFSR",
  158466. "parameters": {
  158467. },
  158468. "attributes": {
  158469. "module_not_derived": "00000000000000000000000000000001",
  158470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  158471. },
  158472. "port_directions": {
  158473. "C": "input",
  158474. "D": "input",
  158475. "Q": "output",
  158476. "R": "input"
  158477. },
  158478. "connections": {
  158479. "C": [ 42 ],
  158480. "D": [ 6634 ],
  158481. "Q": [ 6554 ],
  158482. "R": [ 6611 ]
  158483. }
  158484. },
  158485. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_3": {
  158486. "hide_name": 0,
  158487. "type": "SB_DFFSR",
  158488. "parameters": {
  158489. },
  158490. "attributes": {
  158491. "module_not_derived": "00000000000000000000000000000001",
  158492. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  158493. },
  158494. "port_directions": {
  158495. "C": "input",
  158496. "D": "input",
  158497. "Q": "output",
  158498. "R": "input"
  158499. },
  158500. "connections": {
  158501. "C": [ 42 ],
  158502. "D": [ 6635 ],
  158503. "Q": [ 6553 ],
  158504. "R": [ 6611 ]
  158505. }
  158506. },
  158507. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_4": {
  158508. "hide_name": 0,
  158509. "type": "SB_DFFSR",
  158510. "parameters": {
  158511. },
  158512. "attributes": {
  158513. "module_not_derived": "00000000000000000000000000000001",
  158514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  158515. },
  158516. "port_directions": {
  158517. "C": "input",
  158518. "D": "input",
  158519. "Q": "output",
  158520. "R": "input"
  158521. },
  158522. "connections": {
  158523. "C": [ 42 ],
  158524. "D": [ 6636 ],
  158525. "Q": [ 6552 ],
  158526. "R": [ 6611 ]
  158527. }
  158528. },
  158529. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_5": {
  158530. "hide_name": 0,
  158531. "type": "SB_DFFSR",
  158532. "parameters": {
  158533. },
  158534. "attributes": {
  158535. "module_not_derived": "00000000000000000000000000000001",
  158536. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  158537. },
  158538. "port_directions": {
  158539. "C": "input",
  158540. "D": "input",
  158541. "Q": "output",
  158542. "R": "input"
  158543. },
  158544. "connections": {
  158545. "C": [ 42 ],
  158546. "D": [ 6637 ],
  158547. "Q": [ 6550 ],
  158548. "R": [ 6611 ]
  158549. }
  158550. },
  158551. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O": {
  158552. "hide_name": 0,
  158553. "type": "SB_LUT4",
  158554. "parameters": {
  158555. "LUT_INIT": "0110100110010110"
  158556. },
  158557. "attributes": {
  158558. "module_not_derived": "00000000000000000000000000000001",
  158559. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158560. },
  158561. "port_directions": {
  158562. "I0": "input",
  158563. "I1": "input",
  158564. "I2": "input",
  158565. "I3": "input",
  158566. "O": "output"
  158567. },
  158568. "connections": {
  158569. "I0": [ "0" ],
  158570. "I1": [ 6582 ],
  158571. "I2": [ 6583 ],
  158572. "I3": [ "0" ],
  158573. "O": [ 6632 ]
  158574. }
  158575. },
  158576. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_1": {
  158577. "hide_name": 0,
  158578. "type": "SB_LUT4",
  158579. "parameters": {
  158580. "LUT_INIT": "0110100110010110"
  158581. },
  158582. "attributes": {
  158583. "module_not_derived": "00000000000000000000000000000001",
  158584. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158585. },
  158586. "port_directions": {
  158587. "I0": "input",
  158588. "I1": "input",
  158589. "I2": "input",
  158590. "I3": "input",
  158591. "O": "output"
  158592. },
  158593. "connections": {
  158594. "I0": [ "0" ],
  158595. "I1": [ "0" ],
  158596. "I2": [ 6581 ],
  158597. "I3": [ 6638 ],
  158598. "O": [ 6633 ]
  158599. }
  158600. },
  158601. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  158602. "hide_name": 0,
  158603. "type": "SB_CARRY",
  158604. "parameters": {
  158605. },
  158606. "attributes": {
  158607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158608. },
  158609. "port_directions": {
  158610. "CI": "input",
  158611. "CO": "output",
  158612. "I0": "input",
  158613. "I1": "input"
  158614. },
  158615. "connections": {
  158616. "CI": [ "0" ],
  158617. "CO": [ 6638 ],
  158618. "I0": [ 6582 ],
  158619. "I1": [ 6583 ]
  158620. }
  158621. },
  158622. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_2": {
  158623. "hide_name": 0,
  158624. "type": "SB_LUT4",
  158625. "parameters": {
  158626. "LUT_INIT": "0110100110010110"
  158627. },
  158628. "attributes": {
  158629. "module_not_derived": "00000000000000000000000000000001",
  158630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158631. },
  158632. "port_directions": {
  158633. "I0": "input",
  158634. "I1": "input",
  158635. "I2": "input",
  158636. "I3": "input",
  158637. "O": "output"
  158638. },
  158639. "connections": {
  158640. "I0": [ "0" ],
  158641. "I1": [ "0" ],
  158642. "I2": [ 6554 ],
  158643. "I3": [ 6639 ],
  158644. "O": [ 6634 ]
  158645. }
  158646. },
  158647. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  158648. "hide_name": 0,
  158649. "type": "SB_CARRY",
  158650. "parameters": {
  158651. },
  158652. "attributes": {
  158653. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158654. },
  158655. "port_directions": {
  158656. "CI": "input",
  158657. "CO": "output",
  158658. "I0": "input",
  158659. "I1": "input"
  158660. },
  158661. "connections": {
  158662. "CI": [ 6638 ],
  158663. "CO": [ 6639 ],
  158664. "I0": [ "0" ],
  158665. "I1": [ 6581 ]
  158666. }
  158667. },
  158668. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_3": {
  158669. "hide_name": 0,
  158670. "type": "SB_LUT4",
  158671. "parameters": {
  158672. "LUT_INIT": "0110100110010110"
  158673. },
  158674. "attributes": {
  158675. "module_not_derived": "00000000000000000000000000000001",
  158676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158677. },
  158678. "port_directions": {
  158679. "I0": "input",
  158680. "I1": "input",
  158681. "I2": "input",
  158682. "I3": "input",
  158683. "O": "output"
  158684. },
  158685. "connections": {
  158686. "I0": [ "0" ],
  158687. "I1": [ "0" ],
  158688. "I2": [ 6553 ],
  158689. "I3": [ 6640 ],
  158690. "O": [ 6635 ]
  158691. }
  158692. },
  158693. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  158694. "hide_name": 0,
  158695. "type": "SB_CARRY",
  158696. "parameters": {
  158697. },
  158698. "attributes": {
  158699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158700. },
  158701. "port_directions": {
  158702. "CI": "input",
  158703. "CO": "output",
  158704. "I0": "input",
  158705. "I1": "input"
  158706. },
  158707. "connections": {
  158708. "CI": [ 6639 ],
  158709. "CO": [ 6640 ],
  158710. "I0": [ "0" ],
  158711. "I1": [ 6554 ]
  158712. }
  158713. },
  158714. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_4": {
  158715. "hide_name": 0,
  158716. "type": "SB_LUT4",
  158717. "parameters": {
  158718. "LUT_INIT": "0110100110010110"
  158719. },
  158720. "attributes": {
  158721. "module_not_derived": "00000000000000000000000000000001",
  158722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158723. },
  158724. "port_directions": {
  158725. "I0": "input",
  158726. "I1": "input",
  158727. "I2": "input",
  158728. "I3": "input",
  158729. "O": "output"
  158730. },
  158731. "connections": {
  158732. "I0": [ "0" ],
  158733. "I1": [ "0" ],
  158734. "I2": [ 6552 ],
  158735. "I3": [ 6641 ],
  158736. "O": [ 6636 ]
  158737. }
  158738. },
  158739. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  158740. "hide_name": 0,
  158741. "type": "SB_CARRY",
  158742. "parameters": {
  158743. },
  158744. "attributes": {
  158745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158746. },
  158747. "port_directions": {
  158748. "CI": "input",
  158749. "CO": "output",
  158750. "I0": "input",
  158751. "I1": "input"
  158752. },
  158753. "connections": {
  158754. "CI": [ 6640 ],
  158755. "CO": [ 6641 ],
  158756. "I0": [ "0" ],
  158757. "I1": [ 6553 ]
  158758. }
  158759. },
  158760. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5": {
  158761. "hide_name": 0,
  158762. "type": "SB_LUT4",
  158763. "parameters": {
  158764. "LUT_INIT": "0110100110010110"
  158765. },
  158766. "attributes": {
  158767. "module_not_derived": "00000000000000000000000000000001",
  158768. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158769. },
  158770. "port_directions": {
  158771. "I0": "input",
  158772. "I1": "input",
  158773. "I2": "input",
  158774. "I3": "input",
  158775. "O": "output"
  158776. },
  158777. "connections": {
  158778. "I0": [ "0" ],
  158779. "I1": [ "0" ],
  158780. "I2": [ 6550 ],
  158781. "I3": [ 6642 ],
  158782. "O": [ 6637 ]
  158783. }
  158784. },
  158785. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI": {
  158786. "hide_name": 0,
  158787. "type": "SB_CARRY",
  158788. "parameters": {
  158789. },
  158790. "attributes": {
  158791. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158792. },
  158793. "port_directions": {
  158794. "CI": "input",
  158795. "CO": "output",
  158796. "I0": "input",
  158797. "I1": "input"
  158798. },
  158799. "connections": {
  158800. "CI": [ 6642 ],
  158801. "CO": [ 6643 ],
  158802. "I0": [ "0" ],
  158803. "I1": [ 6550 ]
  158804. }
  158805. },
  158806. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI": {
  158807. "hide_name": 0,
  158808. "type": "SB_CARRY",
  158809. "parameters": {
  158810. },
  158811. "attributes": {
  158812. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158813. },
  158814. "port_directions": {
  158815. "CI": "input",
  158816. "CO": "output",
  158817. "I0": "input",
  158818. "I1": "input"
  158819. },
  158820. "connections": {
  158821. "CI": [ 6643 ],
  158822. "CO": [ 6644 ],
  158823. "I0": [ "0" ],
  158824. "I1": [ 6563 ]
  158825. }
  158826. },
  158827. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI": {
  158828. "hide_name": 0,
  158829. "type": "SB_CARRY",
  158830. "parameters": {
  158831. },
  158832. "attributes": {
  158833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158834. },
  158835. "port_directions": {
  158836. "CI": "input",
  158837. "CO": "output",
  158838. "I0": "input",
  158839. "I1": "input"
  158840. },
  158841. "connections": {
  158842. "CI": [ 6644 ],
  158843. "CO": [ 6645 ],
  158844. "I0": [ "0" ],
  158845. "I1": [ 6562 ]
  158846. }
  158847. },
  158848. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI": {
  158849. "hide_name": 0,
  158850. "type": "SB_CARRY",
  158851. "parameters": {
  158852. },
  158853. "attributes": {
  158854. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158855. },
  158856. "port_directions": {
  158857. "CI": "input",
  158858. "CO": "output",
  158859. "I0": "input",
  158860. "I1": "input"
  158861. },
  158862. "connections": {
  158863. "CI": [ 6645 ],
  158864. "CO": [ 6646 ],
  158865. "I0": [ "0" ],
  158866. "I1": [ 6561 ]
  158867. }
  158868. },
  158869. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI": {
  158870. "hide_name": 0,
  158871. "type": "SB_CARRY",
  158872. "parameters": {
  158873. },
  158874. "attributes": {
  158875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  158876. },
  158877. "port_directions": {
  158878. "CI": "input",
  158879. "CO": "output",
  158880. "I0": "input",
  158881. "I1": "input"
  158882. },
  158883. "connections": {
  158884. "CI": [ 6646 ],
  158885. "CO": [ 6647 ],
  158886. "I0": [ "0" ],
  158887. "I1": [ 6560 ]
  158888. }
  158889. },
  158890. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3": {
  158891. "hide_name": 0,
  158892. "type": "SB_LUT4",
  158893. "parameters": {
  158894. "LUT_INIT": "0110100110010110"
  158895. },
  158896. "attributes": {
  158897. "module_not_derived": "00000000000000000000000000000001",
  158898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  158899. },
  158900. "port_directions": {
  158901. "I0": "input",
  158902. "I1": "input",
  158903. "I2": "input",
  158904. "I3": "input",
  158905. "O": "output"
  158906. },
  158907. "connections": {
  158908. "I0": [ "0" ],
  158909. "I1": [ "0" ],
  158910. "I2": [ 6561 ],
  158911. "I3": [ 6645 ],
  158912. "O": [ 6648 ]
  158913. }
  158914. },
  158915. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q": {
  158916. "hide_name": 0,
  158917. "type": "SB_DFFR",
  158918. "parameters": {
  158919. },
  158920. "attributes": {
  158921. "module_not_derived": "00000000000000000000000000000001",
  158922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  158923. },
  158924. "port_directions": {
  158925. "C": "input",
  158926. "D": "input",
  158927. "Q": "output",
  158928. "R": "input"
  158929. },
  158930. "connections": {
  158931. "C": [ 42 ],
  158932. "D": [ 6649 ],
  158933. "Q": [ 6613 ],
  158934. "R": [ 127 ]
  158935. }
  158936. },
  158937. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q_D_SB_LUT4_O": {
  158938. "hide_name": 0,
  158939. "type": "SB_LUT4",
  158940. "parameters": {
  158941. "LUT_INIT": "1100000000000000"
  158942. },
  158943. "attributes": {
  158944. "module_not_derived": "00000000000000000000000000000001",
  158945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  158946. },
  158947. "port_directions": {
  158948. "I0": "input",
  158949. "I1": "input",
  158950. "I2": "input",
  158951. "I3": "input",
  158952. "O": "output"
  158953. },
  158954. "connections": {
  158955. "I0": [ "0" ],
  158956. "I1": [ 6650 ],
  158957. "I2": [ 6651 ],
  158958. "I3": [ 6652 ],
  158959. "O": [ 6649 ]
  158960. }
  158961. },
  158962. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_DFFS_Q": {
  158963. "hide_name": 0,
  158964. "type": "SB_DFFS",
  158965. "parameters": {
  158966. },
  158967. "attributes": {
  158968. "module_not_derived": "00000000000000000000000000000001",
  158969. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:135.2-139.22|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  158970. },
  158971. "port_directions": {
  158972. "C": "input",
  158973. "D": "input",
  158974. "Q": "output",
  158975. "S": "input"
  158976. },
  158977. "connections": {
  158978. "C": [ 42 ],
  158979. "D": [ 6653 ],
  158980. "Q": [ 6652 ],
  158981. "S": [ 127 ]
  158982. }
  158983. },
  158984. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_LUT4_I1": {
  158985. "hide_name": 0,
  158986. "type": "SB_LUT4",
  158987. "parameters": {
  158988. "LUT_INIT": "1111000011001100"
  158989. },
  158990. "attributes": {
  158991. "module_not_derived": "00000000000000000000000000000001",
  158992. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  158993. },
  158994. "port_directions": {
  158995. "I0": "input",
  158996. "I1": "input",
  158997. "I2": "input",
  158998. "I3": "input",
  158999. "O": "output"
  159000. },
  159001. "connections": {
  159002. "I0": [ "0" ],
  159003. "I1": [ 6652 ],
  159004. "I2": [ 6654 ],
  159005. "I3": [ 6655 ],
  159006. "O": [ 6653 ]
  159007. }
  159008. },
  159009. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3": {
  159010. "hide_name": 0,
  159011. "type": "SB_LUT4",
  159012. "parameters": {
  159013. "LUT_INIT": "0110100110010110"
  159014. },
  159015. "attributes": {
  159016. "module_not_derived": "00000000000000000000000000000001",
  159017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159018. },
  159019. "port_directions": {
  159020. "I0": "input",
  159021. "I1": "input",
  159022. "I2": "input",
  159023. "I3": "input",
  159024. "O": "output"
  159025. },
  159026. "connections": {
  159027. "I0": [ "0" ],
  159028. "I1": [ "0" ],
  159029. "I2": [ 6562 ],
  159030. "I3": [ 6644 ],
  159031. "O": [ 6656 ]
  159032. }
  159033. },
  159034. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3": {
  159035. "hide_name": 0,
  159036. "type": "SB_LUT4",
  159037. "parameters": {
  159038. "LUT_INIT": "0110100110010110"
  159039. },
  159040. "attributes": {
  159041. "module_not_derived": "00000000000000000000000000000001",
  159042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159043. },
  159044. "port_directions": {
  159045. "I0": "input",
  159046. "I1": "input",
  159047. "I2": "input",
  159048. "I3": "input",
  159049. "O": "output"
  159050. },
  159051. "connections": {
  159052. "I0": [ "0" ],
  159053. "I1": [ "0" ],
  159054. "I2": [ 6563 ],
  159055. "I3": [ 6643 ],
  159056. "O": [ 6657 ]
  159057. }
  159058. },
  159059. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3": {
  159060. "hide_name": 0,
  159061. "type": "SB_LUT4",
  159062. "parameters": {
  159063. "LUT_INIT": "0011101100001000"
  159064. },
  159065. "attributes": {
  159066. "module_not_derived": "00000000000000000000000000000001",
  159067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159068. },
  159069. "port_directions": {
  159070. "I0": "input",
  159071. "I1": "input",
  159072. "I2": "input",
  159073. "I3": "input",
  159074. "O": "output"
  159075. },
  159076. "connections": {
  159077. "I0": [ 6631 ],
  159078. "I1": [ 6611 ],
  159079. "I2": [ 6613 ],
  159080. "I3": [ 6657 ],
  159081. "O": [ 6658 ]
  159082. }
  159083. },
  159084. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O": {
  159085. "hide_name": 0,
  159086. "type": "SB_LUT4",
  159087. "parameters": {
  159088. "LUT_INIT": "0011101100001000"
  159089. },
  159090. "attributes": {
  159091. "module_not_derived": "00000000000000000000000000000001",
  159092. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159093. },
  159094. "port_directions": {
  159095. "I0": "input",
  159096. "I1": "input",
  159097. "I2": "input",
  159098. "I3": "input",
  159099. "O": "output"
  159100. },
  159101. "connections": {
  159102. "I0": [ 6629 ],
  159103. "I1": [ 6611 ],
  159104. "I2": [ 6613 ],
  159105. "I3": [ 6656 ],
  159106. "O": [ 6659 ]
  159107. }
  159108. },
  159109. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1": {
  159110. "hide_name": 0,
  159111. "type": "SB_LUT4",
  159112. "parameters": {
  159113. "LUT_INIT": "0011101100001000"
  159114. },
  159115. "attributes": {
  159116. "module_not_derived": "00000000000000000000000000000001",
  159117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159118. },
  159119. "port_directions": {
  159120. "I0": "input",
  159121. "I1": "input",
  159122. "I2": "input",
  159123. "I3": "input",
  159124. "O": "output"
  159125. },
  159126. "connections": {
  159127. "I0": [ 6627 ],
  159128. "I1": [ 6611 ],
  159129. "I2": [ 6613 ],
  159130. "I3": [ 6648 ],
  159131. "O": [ 6660 ]
  159132. }
  159133. },
  159134. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2": {
  159135. "hide_name": 0,
  159136. "type": "SB_LUT4",
  159137. "parameters": {
  159138. "LUT_INIT": "0011101100001000"
  159139. },
  159140. "attributes": {
  159141. "module_not_derived": "00000000000000000000000000000001",
  159142. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159143. },
  159144. "port_directions": {
  159145. "I0": "input",
  159146. "I1": "input",
  159147. "I2": "input",
  159148. "I3": "input",
  159149. "O": "output"
  159150. },
  159151. "connections": {
  159152. "I0": [ 6625 ],
  159153. "I1": [ 6611 ],
  159154. "I2": [ 6613 ],
  159155. "I3": [ 6661 ],
  159156. "O": [ 6662 ]
  159157. }
  159158. },
  159159. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2_I3_SB_LUT4_O": {
  159160. "hide_name": 0,
  159161. "type": "SB_LUT4",
  159162. "parameters": {
  159163. "LUT_INIT": "0110100110010110"
  159164. },
  159165. "attributes": {
  159166. "module_not_derived": "00000000000000000000000000000001",
  159167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159168. },
  159169. "port_directions": {
  159170. "I0": "input",
  159171. "I1": "input",
  159172. "I2": "input",
  159173. "I3": "input",
  159174. "O": "output"
  159175. },
  159176. "connections": {
  159177. "I0": [ "0" ],
  159178. "I1": [ "0" ],
  159179. "I2": [ 6560 ],
  159180. "I3": [ 6646 ],
  159181. "O": [ 6661 ]
  159182. }
  159183. },
  159184. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3": {
  159185. "hide_name": 0,
  159186. "type": "SB_LUT4",
  159187. "parameters": {
  159188. "LUT_INIT": "0011101100001000"
  159189. },
  159190. "attributes": {
  159191. "module_not_derived": "00000000000000000000000000000001",
  159192. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159193. },
  159194. "port_directions": {
  159195. "I0": "input",
  159196. "I1": "input",
  159197. "I2": "input",
  159198. "I3": "input",
  159199. "O": "output"
  159200. },
  159201. "connections": {
  159202. "I0": [ 6623 ],
  159203. "I1": [ 6611 ],
  159204. "I2": [ 6613 ],
  159205. "I3": [ 6663 ],
  159206. "O": [ 6664 ]
  159207. }
  159208. },
  159209. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3_SB_LUT4_O": {
  159210. "hide_name": 0,
  159211. "type": "SB_LUT4",
  159212. "parameters": {
  159213. "LUT_INIT": "0110100110010110"
  159214. },
  159215. "attributes": {
  159216. "module_not_derived": "00000000000000000000000000000001",
  159217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159218. },
  159219. "port_directions": {
  159220. "I0": "input",
  159221. "I1": "input",
  159222. "I2": "input",
  159223. "I3": "input",
  159224. "O": "output"
  159225. },
  159226. "connections": {
  159227. "I0": [ "0" ],
  159228. "I1": [ "0" ],
  159229. "I2": [ 6559 ],
  159230. "I3": [ 6647 ],
  159231. "O": [ 6663 ]
  159232. }
  159233. },
  159234. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4": {
  159235. "hide_name": 0,
  159236. "type": "SB_LUT4",
  159237. "parameters": {
  159238. "LUT_INIT": "0011101100001000"
  159239. },
  159240. "attributes": {
  159241. "module_not_derived": "00000000000000000000000000000001",
  159242. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159243. },
  159244. "port_directions": {
  159245. "I0": "input",
  159246. "I1": "input",
  159247. "I2": "input",
  159248. "I3": "input",
  159249. "O": "output"
  159250. },
  159251. "connections": {
  159252. "I0": [ 6621 ],
  159253. "I1": [ 6611 ],
  159254. "I2": [ 6613 ],
  159255. "I3": [ 6665 ],
  159256. "O": [ 6666 ]
  159257. }
  159258. },
  159259. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3_SB_LUT4_O": {
  159260. "hide_name": 0,
  159261. "type": "SB_LUT4",
  159262. "parameters": {
  159263. "LUT_INIT": "0110100110010110"
  159264. },
  159265. "attributes": {
  159266. "module_not_derived": "00000000000000000000000000000001",
  159267. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159268. },
  159269. "port_directions": {
  159270. "I0": "input",
  159271. "I1": "input",
  159272. "I2": "input",
  159273. "I3": "input",
  159274. "O": "output"
  159275. },
  159276. "connections": {
  159277. "I0": [ "0" ],
  159278. "I1": [ "0" ],
  159279. "I2": [ 6558 ],
  159280. "I3": [ 6667 ],
  159281. "O": [ 6665 ]
  159282. }
  159283. },
  159284. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  159285. "hide_name": 0,
  159286. "type": "SB_CARRY",
  159287. "parameters": {
  159288. },
  159289. "attributes": {
  159290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  159291. },
  159292. "port_directions": {
  159293. "CI": "input",
  159294. "CO": "output",
  159295. "I0": "input",
  159296. "I1": "input"
  159297. },
  159298. "connections": {
  159299. "CI": [ 6647 ],
  159300. "CO": [ 6667 ],
  159301. "I0": [ "0" ],
  159302. "I1": [ 6559 ]
  159303. }
  159304. },
  159305. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5": {
  159306. "hide_name": 0,
  159307. "type": "SB_LUT4",
  159308. "parameters": {
  159309. "LUT_INIT": "0011101100001000"
  159310. },
  159311. "attributes": {
  159312. "module_not_derived": "00000000000000000000000000000001",
  159313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159314. },
  159315. "port_directions": {
  159316. "I0": "input",
  159317. "I1": "input",
  159318. "I2": "input",
  159319. "I3": "input",
  159320. "O": "output"
  159321. },
  159322. "connections": {
  159323. "I0": [ 6619 ],
  159324. "I1": [ 6611 ],
  159325. "I2": [ 6613 ],
  159326. "I3": [ 6668 ],
  159327. "O": [ 6669 ]
  159328. }
  159329. },
  159330. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3_SB_LUT4_O": {
  159331. "hide_name": 0,
  159332. "type": "SB_LUT4",
  159333. "parameters": {
  159334. "LUT_INIT": "0110100110010110"
  159335. },
  159336. "attributes": {
  159337. "module_not_derived": "00000000000000000000000000000001",
  159338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159339. },
  159340. "port_directions": {
  159341. "I0": "input",
  159342. "I1": "input",
  159343. "I2": "input",
  159344. "I3": "input",
  159345. "O": "output"
  159346. },
  159347. "connections": {
  159348. "I0": [ "0" ],
  159349. "I1": [ "0" ],
  159350. "I2": [ 6557 ],
  159351. "I3": [ 6670 ],
  159352. "O": [ 6668 ]
  159353. }
  159354. },
  159355. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  159356. "hide_name": 0,
  159357. "type": "SB_CARRY",
  159358. "parameters": {
  159359. },
  159360. "attributes": {
  159361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  159362. },
  159363. "port_directions": {
  159364. "CI": "input",
  159365. "CO": "output",
  159366. "I0": "input",
  159367. "I1": "input"
  159368. },
  159369. "connections": {
  159370. "CI": [ 6667 ],
  159371. "CO": [ 6670 ],
  159372. "I0": [ "0" ],
  159373. "I1": [ 6558 ]
  159374. }
  159375. },
  159376. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6": {
  159377. "hide_name": 0,
  159378. "type": "SB_LUT4",
  159379. "parameters": {
  159380. "LUT_INIT": "0011101100001000"
  159381. },
  159382. "attributes": {
  159383. "module_not_derived": "00000000000000000000000000000001",
  159384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159385. },
  159386. "port_directions": {
  159387. "I0": "input",
  159388. "I1": "input",
  159389. "I2": "input",
  159390. "I3": "input",
  159391. "O": "output"
  159392. },
  159393. "connections": {
  159394. "I0": [ 6617 ],
  159395. "I1": [ 6611 ],
  159396. "I2": [ 6613 ],
  159397. "I3": [ 6671 ],
  159398. "O": [ 6672 ]
  159399. }
  159400. },
  159401. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3_SB_LUT4_O": {
  159402. "hide_name": 0,
  159403. "type": "SB_LUT4",
  159404. "parameters": {
  159405. "LUT_INIT": "0110100110010110"
  159406. },
  159407. "attributes": {
  159408. "module_not_derived": "00000000000000000000000000000001",
  159409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159410. },
  159411. "port_directions": {
  159412. "I0": "input",
  159413. "I1": "input",
  159414. "I2": "input",
  159415. "I3": "input",
  159416. "O": "output"
  159417. },
  159418. "connections": {
  159419. "I0": [ "0" ],
  159420. "I1": [ "0" ],
  159421. "I2": [ 6556 ],
  159422. "I3": [ 6673 ],
  159423. "O": [ 6671 ]
  159424. }
  159425. },
  159426. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  159427. "hide_name": 0,
  159428. "type": "SB_CARRY",
  159429. "parameters": {
  159430. },
  159431. "attributes": {
  159432. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  159433. },
  159434. "port_directions": {
  159435. "CI": "input",
  159436. "CO": "output",
  159437. "I0": "input",
  159438. "I1": "input"
  159439. },
  159440. "connections": {
  159441. "CI": [ 6670 ],
  159442. "CO": [ 6673 ],
  159443. "I0": [ "0" ],
  159444. "I1": [ 6557 ]
  159445. }
  159446. },
  159447. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7": {
  159448. "hide_name": 0,
  159449. "type": "SB_LUT4",
  159450. "parameters": {
  159451. "LUT_INIT": "0011101100001000"
  159452. },
  159453. "attributes": {
  159454. "module_not_derived": "00000000000000000000000000000001",
  159455. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159456. },
  159457. "port_directions": {
  159458. "I0": "input",
  159459. "I1": "input",
  159460. "I2": "input",
  159461. "I3": "input",
  159462. "O": "output"
  159463. },
  159464. "connections": {
  159465. "I0": [ 6615 ],
  159466. "I1": [ 6611 ],
  159467. "I2": [ 6613 ],
  159468. "I3": [ 6674 ],
  159469. "O": [ 6675 ]
  159470. }
  159471. },
  159472. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3_SB_LUT4_O": {
  159473. "hide_name": 0,
  159474. "type": "SB_LUT4",
  159475. "parameters": {
  159476. "LUT_INIT": "0110100110010110"
  159477. },
  159478. "attributes": {
  159479. "module_not_derived": "00000000000000000000000000000001",
  159480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159481. },
  159482. "port_directions": {
  159483. "I0": "input",
  159484. "I1": "input",
  159485. "I2": "input",
  159486. "I3": "input",
  159487. "O": "output"
  159488. },
  159489. "connections": {
  159490. "I0": [ "0" ],
  159491. "I1": [ "0" ],
  159492. "I2": [ 6555 ],
  159493. "I3": [ 6676 ],
  159494. "O": [ 6674 ]
  159495. }
  159496. },
  159497. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  159498. "hide_name": 0,
  159499. "type": "SB_CARRY",
  159500. "parameters": {
  159501. },
  159502. "attributes": {
  159503. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  159504. },
  159505. "port_directions": {
  159506. "CI": "input",
  159507. "CO": "output",
  159508. "I0": "input",
  159509. "I1": "input"
  159510. },
  159511. "connections": {
  159512. "CI": [ 6673 ],
  159513. "CO": [ 6676 ],
  159514. "I0": [ "0" ],
  159515. "I1": [ 6556 ]
  159516. }
  159517. },
  159518. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8": {
  159519. "hide_name": 0,
  159520. "type": "SB_LUT4",
  159521. "parameters": {
  159522. "LUT_INIT": "0011101100001000"
  159523. },
  159524. "attributes": {
  159525. "module_not_derived": "00000000000000000000000000000001",
  159526. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159527. },
  159528. "port_directions": {
  159529. "I0": "input",
  159530. "I1": "input",
  159531. "I2": "input",
  159532. "I3": "input",
  159533. "O": "output"
  159534. },
  159535. "connections": {
  159536. "I0": [ 6612 ],
  159537. "I1": [ 6611 ],
  159538. "I2": [ 6613 ],
  159539. "I3": [ 6677 ],
  159540. "O": [ 6678 ]
  159541. }
  159542. },
  159543. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I3_SB_LUT4_O": {
  159544. "hide_name": 0,
  159545. "type": "SB_LUT4",
  159546. "parameters": {
  159547. "LUT_INIT": "0110100110010110"
  159548. },
  159549. "attributes": {
  159550. "module_not_derived": "00000000000000000000000000000001",
  159551. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  159552. },
  159553. "port_directions": {
  159554. "I0": "input",
  159555. "I1": "input",
  159556. "I2": "input",
  159557. "I3": "input",
  159558. "O": "output"
  159559. },
  159560. "connections": {
  159561. "I0": [ "0" ],
  159562. "I1": [ "0" ],
  159563. "I2": [ 6564 ],
  159564. "I3": [ 6679 ],
  159565. "O": [ 6677 ]
  159566. }
  159567. },
  159568. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  159569. "hide_name": 0,
  159570. "type": "SB_CARRY",
  159571. "parameters": {
  159572. },
  159573. "attributes": {
  159574. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  159575. },
  159576. "port_directions": {
  159577. "CI": "input",
  159578. "CO": "output",
  159579. "I0": "input",
  159580. "I1": "input"
  159581. },
  159582. "connections": {
  159583. "CI": [ 6676 ],
  159584. "CO": [ 6679 ],
  159585. "I0": [ "0" ],
  159586. "I1": [ 6555 ]
  159587. }
  159588. },
  159589. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  159590. "hide_name": 0,
  159591. "type": "SB_CARRY",
  159592. "parameters": {
  159593. },
  159594. "attributes": {
  159595. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  159596. },
  159597. "port_directions": {
  159598. "CI": "input",
  159599. "CO": "output",
  159600. "I0": "input",
  159601. "I1": "input"
  159602. },
  159603. "connections": {
  159604. "CI": [ 6641 ],
  159605. "CO": [ 6642 ],
  159606. "I0": [ "0" ],
  159607. "I1": [ 6552 ]
  159608. }
  159609. },
  159610. "vid_I.pp_addr_cur_1_SB_DFF_Q": {
  159611. "hide_name": 0,
  159612. "type": "SB_DFF",
  159613. "parameters": {
  159614. },
  159615. "attributes": {
  159616. "module_not_derived": "00000000000000000000000000000001",
  159617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159618. },
  159619. "port_directions": {
  159620. "C": "input",
  159621. "D": "input",
  159622. "Q": "output"
  159623. },
  159624. "connections": {
  159625. "C": [ 42 ],
  159626. "D": [ 6678 ],
  159627. "Q": [ 6564 ]
  159628. }
  159629. },
  159630. "vid_I.pp_addr_cur_1_SB_DFF_Q_1": {
  159631. "hide_name": 0,
  159632. "type": "SB_DFF",
  159633. "parameters": {
  159634. },
  159635. "attributes": {
  159636. "module_not_derived": "00000000000000000000000000000001",
  159637. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159638. },
  159639. "port_directions": {
  159640. "C": "input",
  159641. "D": "input",
  159642. "Q": "output"
  159643. },
  159644. "connections": {
  159645. "C": [ 42 ],
  159646. "D": [ 6675 ],
  159647. "Q": [ 6555 ]
  159648. }
  159649. },
  159650. "vid_I.pp_addr_cur_1_SB_DFF_Q_2": {
  159651. "hide_name": 0,
  159652. "type": "SB_DFF",
  159653. "parameters": {
  159654. },
  159655. "attributes": {
  159656. "module_not_derived": "00000000000000000000000000000001",
  159657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159658. },
  159659. "port_directions": {
  159660. "C": "input",
  159661. "D": "input",
  159662. "Q": "output"
  159663. },
  159664. "connections": {
  159665. "C": [ 42 ],
  159666. "D": [ 6672 ],
  159667. "Q": [ 6556 ]
  159668. }
  159669. },
  159670. "vid_I.pp_addr_cur_1_SB_DFF_Q_3": {
  159671. "hide_name": 0,
  159672. "type": "SB_DFF",
  159673. "parameters": {
  159674. },
  159675. "attributes": {
  159676. "module_not_derived": "00000000000000000000000000000001",
  159677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159678. },
  159679. "port_directions": {
  159680. "C": "input",
  159681. "D": "input",
  159682. "Q": "output"
  159683. },
  159684. "connections": {
  159685. "C": [ 42 ],
  159686. "D": [ 6669 ],
  159687. "Q": [ 6557 ]
  159688. }
  159689. },
  159690. "vid_I.pp_addr_cur_1_SB_DFF_Q_4": {
  159691. "hide_name": 0,
  159692. "type": "SB_DFF",
  159693. "parameters": {
  159694. },
  159695. "attributes": {
  159696. "module_not_derived": "00000000000000000000000000000001",
  159697. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159698. },
  159699. "port_directions": {
  159700. "C": "input",
  159701. "D": "input",
  159702. "Q": "output"
  159703. },
  159704. "connections": {
  159705. "C": [ 42 ],
  159706. "D": [ 6666 ],
  159707. "Q": [ 6558 ]
  159708. }
  159709. },
  159710. "vid_I.pp_addr_cur_1_SB_DFF_Q_5": {
  159711. "hide_name": 0,
  159712. "type": "SB_DFF",
  159713. "parameters": {
  159714. },
  159715. "attributes": {
  159716. "module_not_derived": "00000000000000000000000000000001",
  159717. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159718. },
  159719. "port_directions": {
  159720. "C": "input",
  159721. "D": "input",
  159722. "Q": "output"
  159723. },
  159724. "connections": {
  159725. "C": [ 42 ],
  159726. "D": [ 6664 ],
  159727. "Q": [ 6559 ]
  159728. }
  159729. },
  159730. "vid_I.pp_addr_cur_1_SB_DFF_Q_6": {
  159731. "hide_name": 0,
  159732. "type": "SB_DFF",
  159733. "parameters": {
  159734. },
  159735. "attributes": {
  159736. "module_not_derived": "00000000000000000000000000000001",
  159737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159738. },
  159739. "port_directions": {
  159740. "C": "input",
  159741. "D": "input",
  159742. "Q": "output"
  159743. },
  159744. "connections": {
  159745. "C": [ 42 ],
  159746. "D": [ 6662 ],
  159747. "Q": [ 6560 ]
  159748. }
  159749. },
  159750. "vid_I.pp_addr_cur_1_SB_DFF_Q_7": {
  159751. "hide_name": 0,
  159752. "type": "SB_DFF",
  159753. "parameters": {
  159754. },
  159755. "attributes": {
  159756. "module_not_derived": "00000000000000000000000000000001",
  159757. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159758. },
  159759. "port_directions": {
  159760. "C": "input",
  159761. "D": "input",
  159762. "Q": "output"
  159763. },
  159764. "connections": {
  159765. "C": [ 42 ],
  159766. "D": [ 6660 ],
  159767. "Q": [ 6561 ]
  159768. }
  159769. },
  159770. "vid_I.pp_addr_cur_1_SB_DFF_Q_8": {
  159771. "hide_name": 0,
  159772. "type": "SB_DFF",
  159773. "parameters": {
  159774. },
  159775. "attributes": {
  159776. "module_not_derived": "00000000000000000000000000000001",
  159777. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159778. },
  159779. "port_directions": {
  159780. "C": "input",
  159781. "D": "input",
  159782. "Q": "output"
  159783. },
  159784. "connections": {
  159785. "C": [ 42 ],
  159786. "D": [ 6659 ],
  159787. "Q": [ 6562 ]
  159788. }
  159789. },
  159790. "vid_I.pp_addr_cur_1_SB_DFF_Q_9": {
  159791. "hide_name": 0,
  159792. "type": "SB_DFF",
  159793. "parameters": {
  159794. },
  159795. "attributes": {
  159796. "module_not_derived": "00000000000000000000000000000001",
  159797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:239.2-243.47|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  159798. },
  159799. "port_directions": {
  159800. "C": "input",
  159801. "D": "input",
  159802. "Q": "output"
  159803. },
  159804. "connections": {
  159805. "C": [ 42 ],
  159806. "D": [ 6658 ],
  159807. "Q": [ 6563 ]
  159808. }
  159809. },
  159810. "vid_I.pp_data_3_SB_DFFESR_Q": {
  159811. "hide_name": 0,
  159812. "type": "SB_DFFESR",
  159813. "parameters": {
  159814. },
  159815. "attributes": {
  159816. "module_not_derived": "00000000000000000000000000000001",
  159817. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159818. },
  159819. "port_directions": {
  159820. "C": "input",
  159821. "D": "input",
  159822. "E": "input",
  159823. "Q": "output",
  159824. "R": "input"
  159825. },
  159826. "connections": {
  159827. "C": [ 42 ],
  159828. "D": [ 6488 ],
  159829. "E": [ 6582 ],
  159830. "Q": [ 6680 ],
  159831. "R": [ 6681 ]
  159832. }
  159833. },
  159834. "vid_I.pp_data_3_SB_DFFESR_Q_1": {
  159835. "hide_name": 0,
  159836. "type": "SB_DFFESR",
  159837. "parameters": {
  159838. },
  159839. "attributes": {
  159840. "module_not_derived": "00000000000000000000000000000001",
  159841. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159842. },
  159843. "port_directions": {
  159844. "C": "input",
  159845. "D": "input",
  159846. "E": "input",
  159847. "Q": "output",
  159848. "R": "input"
  159849. },
  159850. "connections": {
  159851. "C": [ 42 ],
  159852. "D": [ 6487 ],
  159853. "E": [ 6582 ],
  159854. "Q": [ 6682 ],
  159855. "R": [ 6681 ]
  159856. }
  159857. },
  159858. "vid_I.pp_data_3_SB_DFFESR_Q_2": {
  159859. "hide_name": 0,
  159860. "type": "SB_DFFESR",
  159861. "parameters": {
  159862. },
  159863. "attributes": {
  159864. "module_not_derived": "00000000000000000000000000000001",
  159865. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159866. },
  159867. "port_directions": {
  159868. "C": "input",
  159869. "D": "input",
  159870. "E": "input",
  159871. "Q": "output",
  159872. "R": "input"
  159873. },
  159874. "connections": {
  159875. "C": [ 42 ],
  159876. "D": [ 6486 ],
  159877. "E": [ 6582 ],
  159878. "Q": [ 6683 ],
  159879. "R": [ 6681 ]
  159880. }
  159881. },
  159882. "vid_I.pp_data_3_SB_DFFESR_Q_3": {
  159883. "hide_name": 0,
  159884. "type": "SB_DFFESR",
  159885. "parameters": {
  159886. },
  159887. "attributes": {
  159888. "module_not_derived": "00000000000000000000000000000001",
  159889. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159890. },
  159891. "port_directions": {
  159892. "C": "input",
  159893. "D": "input",
  159894. "E": "input",
  159895. "Q": "output",
  159896. "R": "input"
  159897. },
  159898. "connections": {
  159899. "C": [ 42 ],
  159900. "D": [ 6485 ],
  159901. "E": [ 6582 ],
  159902. "Q": [ 6684 ],
  159903. "R": [ 6681 ]
  159904. }
  159905. },
  159906. "vid_I.pp_data_3_SB_DFFESR_Q_4": {
  159907. "hide_name": 0,
  159908. "type": "SB_DFFESR",
  159909. "parameters": {
  159910. },
  159911. "attributes": {
  159912. "module_not_derived": "00000000000000000000000000000001",
  159913. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159914. },
  159915. "port_directions": {
  159916. "C": "input",
  159917. "D": "input",
  159918. "E": "input",
  159919. "Q": "output",
  159920. "R": "input"
  159921. },
  159922. "connections": {
  159923. "C": [ 42 ],
  159924. "D": [ 6578 ],
  159925. "E": [ 6582 ],
  159926. "Q": [ 6685 ],
  159927. "R": [ 6681 ]
  159928. }
  159929. },
  159930. "vid_I.pp_data_3_SB_DFFESR_Q_5": {
  159931. "hide_name": 0,
  159932. "type": "SB_DFFESR",
  159933. "parameters": {
  159934. },
  159935. "attributes": {
  159936. "module_not_derived": "00000000000000000000000000000001",
  159937. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159938. },
  159939. "port_directions": {
  159940. "C": "input",
  159941. "D": "input",
  159942. "E": "input",
  159943. "Q": "output",
  159944. "R": "input"
  159945. },
  159946. "connections": {
  159947. "C": [ 42 ],
  159948. "D": [ 6577 ],
  159949. "E": [ 6582 ],
  159950. "Q": [ 6686 ],
  159951. "R": [ 6681 ]
  159952. }
  159953. },
  159954. "vid_I.pp_data_3_SB_DFFESR_Q_6": {
  159955. "hide_name": 0,
  159956. "type": "SB_DFFESR",
  159957. "parameters": {
  159958. },
  159959. "attributes": {
  159960. "module_not_derived": "00000000000000000000000000000001",
  159961. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159962. },
  159963. "port_directions": {
  159964. "C": "input",
  159965. "D": "input",
  159966. "E": "input",
  159967. "Q": "output",
  159968. "R": "input"
  159969. },
  159970. "connections": {
  159971. "C": [ 42 ],
  159972. "D": [ 6576 ],
  159973. "E": [ 6582 ],
  159974. "Q": [ 6687 ],
  159975. "R": [ 6681 ]
  159976. }
  159977. },
  159978. "vid_I.pp_data_3_SB_DFFESR_Q_7": {
  159979. "hide_name": 0,
  159980. "type": "SB_DFFESR",
  159981. "parameters": {
  159982. },
  159983. "attributes": {
  159984. "module_not_derived": "00000000000000000000000000000001",
  159985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  159986. },
  159987. "port_directions": {
  159988. "C": "input",
  159989. "D": "input",
  159990. "E": "input",
  159991. "Q": "output",
  159992. "R": "input"
  159993. },
  159994. "connections": {
  159995. "C": [ 42 ],
  159996. "D": [ 6575 ],
  159997. "E": [ 6582 ],
  159998. "Q": [ 6688 ],
  159999. "R": [ 6681 ]
  160000. }
  160001. },
  160002. "vid_I.pp_data_3_SB_DFFESR_Q_R_SB_LUT4_O": {
  160003. "hide_name": 0,
  160004. "type": "SB_LUT4",
  160005. "parameters": {
  160006. "LUT_INIT": "0000000011111111"
  160007. },
  160008. "attributes": {
  160009. "module_not_derived": "00000000000000000000000000000001",
  160010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:12.34-13.52"
  160011. },
  160012. "port_directions": {
  160013. "I0": "input",
  160014. "I1": "input",
  160015. "I2": "input",
  160016. "I3": "input",
  160017. "O": "output"
  160018. },
  160019. "connections": {
  160020. "I0": [ "0" ],
  160021. "I1": [ "0" ],
  160022. "I2": [ "0" ],
  160023. "I3": [ 6689 ],
  160024. "O": [ 6681 ]
  160025. }
  160026. },
  160027. "vid_I.pp_data_3_SB_DFFE_Q": {
  160028. "hide_name": 0,
  160029. "type": "SB_DFFE",
  160030. "parameters": {
  160031. },
  160032. "attributes": {
  160033. "module_not_derived": "00000000000000000000000000000001",
  160034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160035. },
  160036. "port_directions": {
  160037. "C": "input",
  160038. "D": "input",
  160039. "E": "input",
  160040. "Q": "output"
  160041. },
  160042. "connections": {
  160043. "C": [ 42 ],
  160044. "D": [ 6690 ],
  160045. "E": [ 6582 ],
  160046. "Q": [ 6691 ]
  160047. }
  160048. },
  160049. "vid_I.pp_data_3_SB_DFFE_Q_1": {
  160050. "hide_name": 0,
  160051. "type": "SB_DFFE",
  160052. "parameters": {
  160053. },
  160054. "attributes": {
  160055. "module_not_derived": "00000000000000000000000000000001",
  160056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160057. },
  160058. "port_directions": {
  160059. "C": "input",
  160060. "D": "input",
  160061. "E": "input",
  160062. "Q": "output"
  160063. },
  160064. "connections": {
  160065. "C": [ 42 ],
  160066. "D": [ 6692 ],
  160067. "E": [ 6582 ],
  160068. "Q": [ 6693 ]
  160069. }
  160070. },
  160071. "vid_I.pp_data_3_SB_DFFE_Q_10": {
  160072. "hide_name": 0,
  160073. "type": "SB_DFFE",
  160074. "parameters": {
  160075. },
  160076. "attributes": {
  160077. "module_not_derived": "00000000000000000000000000000001",
  160078. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160079. },
  160080. "port_directions": {
  160081. "C": "input",
  160082. "D": "input",
  160083. "E": "input",
  160084. "Q": "output"
  160085. },
  160086. "connections": {
  160087. "C": [ 42 ],
  160088. "D": [ 6694 ],
  160089. "E": [ 6582 ],
  160090. "Q": [ 6695 ]
  160091. }
  160092. },
  160093. "vid_I.pp_data_3_SB_DFFE_Q_11": {
  160094. "hide_name": 0,
  160095. "type": "SB_DFFE",
  160096. "parameters": {
  160097. },
  160098. "attributes": {
  160099. "module_not_derived": "00000000000000000000000000000001",
  160100. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160101. },
  160102. "port_directions": {
  160103. "C": "input",
  160104. "D": "input",
  160105. "E": "input",
  160106. "Q": "output"
  160107. },
  160108. "connections": {
  160109. "C": [ 42 ],
  160110. "D": [ 6696 ],
  160111. "E": [ 6582 ],
  160112. "Q": [ 6697 ]
  160113. }
  160114. },
  160115. "vid_I.pp_data_3_SB_DFFE_Q_12": {
  160116. "hide_name": 0,
  160117. "type": "SB_DFFE",
  160118. "parameters": {
  160119. },
  160120. "attributes": {
  160121. "module_not_derived": "00000000000000000000000000000001",
  160122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160123. },
  160124. "port_directions": {
  160125. "C": "input",
  160126. "D": "input",
  160127. "E": "input",
  160128. "Q": "output"
  160129. },
  160130. "connections": {
  160131. "C": [ 42 ],
  160132. "D": [ 6698 ],
  160133. "E": [ 6582 ],
  160134. "Q": [ 6699 ]
  160135. }
  160136. },
  160137. "vid_I.pp_data_3_SB_DFFE_Q_13": {
  160138. "hide_name": 0,
  160139. "type": "SB_DFFE",
  160140. "parameters": {
  160141. },
  160142. "attributes": {
  160143. "module_not_derived": "00000000000000000000000000000001",
  160144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160145. },
  160146. "port_directions": {
  160147. "C": "input",
  160148. "D": "input",
  160149. "E": "input",
  160150. "Q": "output"
  160151. },
  160152. "connections": {
  160153. "C": [ 42 ],
  160154. "D": [ 6700 ],
  160155. "E": [ 6582 ],
  160156. "Q": [ 6701 ]
  160157. }
  160158. },
  160159. "vid_I.pp_data_3_SB_DFFE_Q_14": {
  160160. "hide_name": 0,
  160161. "type": "SB_DFFE",
  160162. "parameters": {
  160163. },
  160164. "attributes": {
  160165. "module_not_derived": "00000000000000000000000000000001",
  160166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160167. },
  160168. "port_directions": {
  160169. "C": "input",
  160170. "D": "input",
  160171. "E": "input",
  160172. "Q": "output"
  160173. },
  160174. "connections": {
  160175. "C": [ 42 ],
  160176. "D": [ 6702 ],
  160177. "E": [ 6582 ],
  160178. "Q": [ 6703 ]
  160179. }
  160180. },
  160181. "vid_I.pp_data_3_SB_DFFE_Q_15": {
  160182. "hide_name": 0,
  160183. "type": "SB_DFFE",
  160184. "parameters": {
  160185. },
  160186. "attributes": {
  160187. "module_not_derived": "00000000000000000000000000000001",
  160188. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160189. },
  160190. "port_directions": {
  160191. "C": "input",
  160192. "D": "input",
  160193. "E": "input",
  160194. "Q": "output"
  160195. },
  160196. "connections": {
  160197. "C": [ 42 ],
  160198. "D": [ 6704 ],
  160199. "E": [ 6582 ],
  160200. "Q": [ 6705 ]
  160201. }
  160202. },
  160203. "vid_I.pp_data_3_SB_DFFE_Q_16": {
  160204. "hide_name": 0,
  160205. "type": "SB_DFFE",
  160206. "parameters": {
  160207. },
  160208. "attributes": {
  160209. "module_not_derived": "00000000000000000000000000000001",
  160210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160211. },
  160212. "port_directions": {
  160213. "C": "input",
  160214. "D": "input",
  160215. "E": "input",
  160216. "Q": "output"
  160217. },
  160218. "connections": {
  160219. "C": [ 42 ],
  160220. "D": [ 6706 ],
  160221. "E": [ 6582 ],
  160222. "Q": [ 6591 ]
  160223. }
  160224. },
  160225. "vid_I.pp_data_3_SB_DFFE_Q_17": {
  160226. "hide_name": 0,
  160227. "type": "SB_DFFE",
  160228. "parameters": {
  160229. },
  160230. "attributes": {
  160231. "module_not_derived": "00000000000000000000000000000001",
  160232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160233. },
  160234. "port_directions": {
  160235. "C": "input",
  160236. "D": "input",
  160237. "E": "input",
  160238. "Q": "output"
  160239. },
  160240. "connections": {
  160241. "C": [ 42 ],
  160242. "D": [ 6707 ],
  160243. "E": [ 6582 ],
  160244. "Q": [ 6590 ]
  160245. }
  160246. },
  160247. "vid_I.pp_data_3_SB_DFFE_Q_18": {
  160248. "hide_name": 0,
  160249. "type": "SB_DFFE",
  160250. "parameters": {
  160251. },
  160252. "attributes": {
  160253. "module_not_derived": "00000000000000000000000000000001",
  160254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160255. },
  160256. "port_directions": {
  160257. "C": "input",
  160258. "D": "input",
  160259. "E": "input",
  160260. "Q": "output"
  160261. },
  160262. "connections": {
  160263. "C": [ 42 ],
  160264. "D": [ 6708 ],
  160265. "E": [ 6582 ],
  160266. "Q": [ 6589 ]
  160267. }
  160268. },
  160269. "vid_I.pp_data_3_SB_DFFE_Q_19": {
  160270. "hide_name": 0,
  160271. "type": "SB_DFFE",
  160272. "parameters": {
  160273. },
  160274. "attributes": {
  160275. "module_not_derived": "00000000000000000000000000000001",
  160276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160277. },
  160278. "port_directions": {
  160279. "C": "input",
  160280. "D": "input",
  160281. "E": "input",
  160282. "Q": "output"
  160283. },
  160284. "connections": {
  160285. "C": [ 42 ],
  160286. "D": [ 6709 ],
  160287. "E": [ 6582 ],
  160288. "Q": [ 6588 ]
  160289. }
  160290. },
  160291. "vid_I.pp_data_3_SB_DFFE_Q_2": {
  160292. "hide_name": 0,
  160293. "type": "SB_DFFE",
  160294. "parameters": {
  160295. },
  160296. "attributes": {
  160297. "module_not_derived": "00000000000000000000000000000001",
  160298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160299. },
  160300. "port_directions": {
  160301. "C": "input",
  160302. "D": "input",
  160303. "E": "input",
  160304. "Q": "output"
  160305. },
  160306. "connections": {
  160307. "C": [ 42 ],
  160308. "D": [ 6710 ],
  160309. "E": [ 6582 ],
  160310. "Q": [ 6711 ]
  160311. }
  160312. },
  160313. "vid_I.pp_data_3_SB_DFFE_Q_20": {
  160314. "hide_name": 0,
  160315. "type": "SB_DFFE",
  160316. "parameters": {
  160317. },
  160318. "attributes": {
  160319. "module_not_derived": "00000000000000000000000000000001",
  160320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160321. },
  160322. "port_directions": {
  160323. "C": "input",
  160324. "D": "input",
  160325. "E": "input",
  160326. "Q": "output"
  160327. },
  160328. "connections": {
  160329. "C": [ 42 ],
  160330. "D": [ 6712 ],
  160331. "E": [ 6582 ],
  160332. "Q": [ 6587 ]
  160333. }
  160334. },
  160335. "vid_I.pp_data_3_SB_DFFE_Q_21": {
  160336. "hide_name": 0,
  160337. "type": "SB_DFFE",
  160338. "parameters": {
  160339. },
  160340. "attributes": {
  160341. "module_not_derived": "00000000000000000000000000000001",
  160342. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160343. },
  160344. "port_directions": {
  160345. "C": "input",
  160346. "D": "input",
  160347. "E": "input",
  160348. "Q": "output"
  160349. },
  160350. "connections": {
  160351. "C": [ 42 ],
  160352. "D": [ 6713 ],
  160353. "E": [ 6582 ],
  160354. "Q": [ 6586 ]
  160355. }
  160356. },
  160357. "vid_I.pp_data_3_SB_DFFE_Q_22": {
  160358. "hide_name": 0,
  160359. "type": "SB_DFFE",
  160360. "parameters": {
  160361. },
  160362. "attributes": {
  160363. "module_not_derived": "00000000000000000000000000000001",
  160364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160365. },
  160366. "port_directions": {
  160367. "C": "input",
  160368. "D": "input",
  160369. "E": "input",
  160370. "Q": "output"
  160371. },
  160372. "connections": {
  160373. "C": [ 42 ],
  160374. "D": [ 6714 ],
  160375. "E": [ 6582 ],
  160376. "Q": [ 6585 ]
  160377. }
  160378. },
  160379. "vid_I.pp_data_3_SB_DFFE_Q_23": {
  160380. "hide_name": 0,
  160381. "type": "SB_DFFE",
  160382. "parameters": {
  160383. },
  160384. "attributes": {
  160385. "module_not_derived": "00000000000000000000000000000001",
  160386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160387. },
  160388. "port_directions": {
  160389. "C": "input",
  160390. "D": "input",
  160391. "E": "input",
  160392. "Q": "output"
  160393. },
  160394. "connections": {
  160395. "C": [ 42 ],
  160396. "D": [ 6715 ],
  160397. "E": [ 6582 ],
  160398. "Q": [ 6584 ]
  160399. }
  160400. },
  160401. "vid_I.pp_data_3_SB_DFFE_Q_3": {
  160402. "hide_name": 0,
  160403. "type": "SB_DFFE",
  160404. "parameters": {
  160405. },
  160406. "attributes": {
  160407. "module_not_derived": "00000000000000000000000000000001",
  160408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160409. },
  160410. "port_directions": {
  160411. "C": "input",
  160412. "D": "input",
  160413. "E": "input",
  160414. "Q": "output"
  160415. },
  160416. "connections": {
  160417. "C": [ 42 ],
  160418. "D": [ 6716 ],
  160419. "E": [ 6582 ],
  160420. "Q": [ 6717 ]
  160421. }
  160422. },
  160423. "vid_I.pp_data_3_SB_DFFE_Q_4": {
  160424. "hide_name": 0,
  160425. "type": "SB_DFFE",
  160426. "parameters": {
  160427. },
  160428. "attributes": {
  160429. "module_not_derived": "00000000000000000000000000000001",
  160430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160431. },
  160432. "port_directions": {
  160433. "C": "input",
  160434. "D": "input",
  160435. "E": "input",
  160436. "Q": "output"
  160437. },
  160438. "connections": {
  160439. "C": [ 42 ],
  160440. "D": [ 6718 ],
  160441. "E": [ 6582 ],
  160442. "Q": [ 6719 ]
  160443. }
  160444. },
  160445. "vid_I.pp_data_3_SB_DFFE_Q_5": {
  160446. "hide_name": 0,
  160447. "type": "SB_DFFE",
  160448. "parameters": {
  160449. },
  160450. "attributes": {
  160451. "module_not_derived": "00000000000000000000000000000001",
  160452. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160453. },
  160454. "port_directions": {
  160455. "C": "input",
  160456. "D": "input",
  160457. "E": "input",
  160458. "Q": "output"
  160459. },
  160460. "connections": {
  160461. "C": [ 42 ],
  160462. "D": [ 6720 ],
  160463. "E": [ 6582 ],
  160464. "Q": [ 6721 ]
  160465. }
  160466. },
  160467. "vid_I.pp_data_3_SB_DFFE_Q_6": {
  160468. "hide_name": 0,
  160469. "type": "SB_DFFE",
  160470. "parameters": {
  160471. },
  160472. "attributes": {
  160473. "module_not_derived": "00000000000000000000000000000001",
  160474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160475. },
  160476. "port_directions": {
  160477. "C": "input",
  160478. "D": "input",
  160479. "E": "input",
  160480. "Q": "output"
  160481. },
  160482. "connections": {
  160483. "C": [ 42 ],
  160484. "D": [ 6722 ],
  160485. "E": [ 6582 ],
  160486. "Q": [ 6723 ]
  160487. }
  160488. },
  160489. "vid_I.pp_data_3_SB_DFFE_Q_7": {
  160490. "hide_name": 0,
  160491. "type": "SB_DFFE",
  160492. "parameters": {
  160493. },
  160494. "attributes": {
  160495. "module_not_derived": "00000000000000000000000000000001",
  160496. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160497. },
  160498. "port_directions": {
  160499. "C": "input",
  160500. "D": "input",
  160501. "E": "input",
  160502. "Q": "output"
  160503. },
  160504. "connections": {
  160505. "C": [ 42 ],
  160506. "D": [ 6724 ],
  160507. "E": [ 6582 ],
  160508. "Q": [ 6725 ]
  160509. }
  160510. },
  160511. "vid_I.pp_data_3_SB_DFFE_Q_8": {
  160512. "hide_name": 0,
  160513. "type": "SB_DFFE",
  160514. "parameters": {
  160515. },
  160516. "attributes": {
  160517. "module_not_derived": "00000000000000000000000000000001",
  160518. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160519. },
  160520. "port_directions": {
  160521. "C": "input",
  160522. "D": "input",
  160523. "E": "input",
  160524. "Q": "output"
  160525. },
  160526. "connections": {
  160527. "C": [ 42 ],
  160528. "D": [ 6726 ],
  160529. "E": [ 6582 ],
  160530. "Q": [ 6727 ]
  160531. }
  160532. },
  160533. "vid_I.pp_data_3_SB_DFFE_Q_9": {
  160534. "hide_name": 0,
  160535. "type": "SB_DFFE",
  160536. "parameters": {
  160537. },
  160538. "attributes": {
  160539. "module_not_derived": "00000000000000000000000000000001",
  160540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:253.2-255.75|/usr/bin/../share/yosys/ice40/ff_map.v:5.57-5.103"
  160541. },
  160542. "port_directions": {
  160543. "C": "input",
  160544. "D": "input",
  160545. "E": "input",
  160546. "Q": "output"
  160547. },
  160548. "connections": {
  160549. "C": [ 42 ],
  160550. "D": [ 6728 ],
  160551. "E": [ 6582 ],
  160552. "Q": [ 6729 ]
  160553. }
  160554. },
  160555. "vid_I.pp_data_load_2_SB_DFF_Q": {
  160556. "hide_name": 0,
  160557. "type": "SB_DFF",
  160558. "parameters": {
  160559. },
  160560. "attributes": {
  160561. "module_not_derived": "00000000000000000000000000000001",
  160562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:250.2-251.31|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  160563. },
  160564. "port_directions": {
  160565. "C": "input",
  160566. "D": "input",
  160567. "Q": "output"
  160568. },
  160569. "connections": {
  160570. "C": [ 42 ],
  160571. "D": [ 6551 ],
  160572. "Q": [ 6689 ]
  160573. }
  160574. },
  160575. "vid_I.pp_data_load_2_SB_LUT4_I3": {
  160576. "hide_name": 0,
  160577. "type": "SB_LUT4",
  160578. "parameters": {
  160579. "LUT_INIT": "1100110011110000"
  160580. },
  160581. "attributes": {
  160582. "module_not_derived": "00000000000000000000000000000001",
  160583. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160584. },
  160585. "port_directions": {
  160586. "I0": "input",
  160587. "I1": "input",
  160588. "I2": "input",
  160589. "I3": "input",
  160590. "O": "output"
  160591. },
  160592. "connections": {
  160593. "I0": [ "0" ],
  160594. "I1": [ 6478 ],
  160595. "I2": [ 6703 ],
  160596. "I3": [ 6689 ],
  160597. "O": [ 6714 ]
  160598. }
  160599. },
  160600. "vid_I.pp_data_load_2_SB_LUT4_I3_1": {
  160601. "hide_name": 0,
  160602. "type": "SB_LUT4",
  160603. "parameters": {
  160604. "LUT_INIT": "1100110011110000"
  160605. },
  160606. "attributes": {
  160607. "module_not_derived": "00000000000000000000000000000001",
  160608. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160609. },
  160610. "port_directions": {
  160611. "I0": "input",
  160612. "I1": "input",
  160613. "I2": "input",
  160614. "I3": "input",
  160615. "O": "output"
  160616. },
  160617. "connections": {
  160618. "I0": [ "0" ],
  160619. "I1": [ 6481 ],
  160620. "I2": [ 6701 ],
  160621. "I3": [ 6689 ],
  160622. "O": [ 6713 ]
  160623. }
  160624. },
  160625. "vid_I.pp_data_load_2_SB_LUT4_I3_10": {
  160626. "hide_name": 0,
  160627. "type": "SB_LUT4",
  160628. "parameters": {
  160629. "LUT_INIT": "1100110011110000"
  160630. },
  160631. "attributes": {
  160632. "module_not_derived": "00000000000000000000000000000001",
  160633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160634. },
  160635. "port_directions": {
  160636. "I0": "input",
  160637. "I1": "input",
  160638. "I2": "input",
  160639. "I3": "input",
  160640. "O": "output"
  160641. },
  160642. "connections": {
  160643. "I0": [ "0" ],
  160644. "I1": [ 6483 ],
  160645. "I2": [ 6719 ],
  160646. "I3": [ 6689 ],
  160647. "O": [ 6698 ]
  160648. }
  160649. },
  160650. "vid_I.pp_data_load_2_SB_LUT4_I3_11": {
  160651. "hide_name": 0,
  160652. "type": "SB_LUT4",
  160653. "parameters": {
  160654. "LUT_INIT": "1100110011110000"
  160655. },
  160656. "attributes": {
  160657. "module_not_derived": "00000000000000000000000000000001",
  160658. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160659. },
  160660. "port_directions": {
  160661. "I0": "input",
  160662. "I1": "input",
  160663. "I2": "input",
  160664. "I3": "input",
  160665. "O": "output"
  160666. },
  160667. "connections": {
  160668. "I0": [ "0" ],
  160669. "I1": [ 6545 ],
  160670. "I2": [ 6717 ],
  160671. "I3": [ 6689 ],
  160672. "O": [ 6696 ]
  160673. }
  160674. },
  160675. "vid_I.pp_data_load_2_SB_LUT4_I3_12": {
  160676. "hide_name": 0,
  160677. "type": "SB_LUT4",
  160678. "parameters": {
  160679. "LUT_INIT": "1100110011110000"
  160680. },
  160681. "attributes": {
  160682. "module_not_derived": "00000000000000000000000000000001",
  160683. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160684. },
  160685. "port_directions": {
  160686. "I0": "input",
  160687. "I1": "input",
  160688. "I2": "input",
  160689. "I3": "input",
  160690. "O": "output"
  160691. },
  160692. "connections": {
  160693. "I0": [ "0" ],
  160694. "I1": [ 6546 ],
  160695. "I2": [ 6711 ],
  160696. "I3": [ 6689 ],
  160697. "O": [ 6694 ]
  160698. }
  160699. },
  160700. "vid_I.pp_data_load_2_SB_LUT4_I3_13": {
  160701. "hide_name": 0,
  160702. "type": "SB_LUT4",
  160703. "parameters": {
  160704. "LUT_INIT": "1100110011110000"
  160705. },
  160706. "attributes": {
  160707. "module_not_derived": "00000000000000000000000000000001",
  160708. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160709. },
  160710. "port_directions": {
  160711. "I0": "input",
  160712. "I1": "input",
  160713. "I2": "input",
  160714. "I3": "input",
  160715. "O": "output"
  160716. },
  160717. "connections": {
  160718. "I0": [ "0" ],
  160719. "I1": [ 6547 ],
  160720. "I2": [ 6693 ],
  160721. "I3": [ 6689 ],
  160722. "O": [ 6728 ]
  160723. }
  160724. },
  160725. "vid_I.pp_data_load_2_SB_LUT4_I3_14": {
  160726. "hide_name": 0,
  160727. "type": "SB_LUT4",
  160728. "parameters": {
  160729. "LUT_INIT": "1100110011110000"
  160730. },
  160731. "attributes": {
  160732. "module_not_derived": "00000000000000000000000000000001",
  160733. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160734. },
  160735. "port_directions": {
  160736. "I0": "input",
  160737. "I1": "input",
  160738. "I2": "input",
  160739. "I3": "input",
  160740. "O": "output"
  160741. },
  160742. "connections": {
  160743. "I0": [ "0" ],
  160744. "I1": [ 6548 ],
  160745. "I2": [ 6691 ],
  160746. "I3": [ 6689 ],
  160747. "O": [ 6726 ]
  160748. }
  160749. },
  160750. "vid_I.pp_data_load_2_SB_LUT4_I3_15": {
  160751. "hide_name": 0,
  160752. "type": "SB_LUT4",
  160753. "parameters": {
  160754. "LUT_INIT": "1100110011110000"
  160755. },
  160756. "attributes": {
  160757. "module_not_derived": "00000000000000000000000000000001",
  160758. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160759. },
  160760. "port_directions": {
  160761. "I0": "input",
  160762. "I1": "input",
  160763. "I2": "input",
  160764. "I3": "input",
  160765. "O": "output"
  160766. },
  160767. "connections": {
  160768. "I0": [ "0" ],
  160769. "I1": [ 6567 ],
  160770. "I2": [ 6688 ],
  160771. "I3": [ 6689 ],
  160772. "O": [ 6724 ]
  160773. }
  160774. },
  160775. "vid_I.pp_data_load_2_SB_LUT4_I3_16": {
  160776. "hide_name": 0,
  160777. "type": "SB_LUT4",
  160778. "parameters": {
  160779. "LUT_INIT": "1100110011110000"
  160780. },
  160781. "attributes": {
  160782. "module_not_derived": "00000000000000000000000000000001",
  160783. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160784. },
  160785. "port_directions": {
  160786. "I0": "input",
  160787. "I1": "input",
  160788. "I2": "input",
  160789. "I3": "input",
  160790. "O": "output"
  160791. },
  160792. "connections": {
  160793. "I0": [ "0" ],
  160794. "I1": [ 6568 ],
  160795. "I2": [ 6687 ],
  160796. "I3": [ 6689 ],
  160797. "O": [ 6722 ]
  160798. }
  160799. },
  160800. "vid_I.pp_data_load_2_SB_LUT4_I3_17": {
  160801. "hide_name": 0,
  160802. "type": "SB_LUT4",
  160803. "parameters": {
  160804. "LUT_INIT": "1100110011110000"
  160805. },
  160806. "attributes": {
  160807. "module_not_derived": "00000000000000000000000000000001",
  160808. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160809. },
  160810. "port_directions": {
  160811. "I0": "input",
  160812. "I1": "input",
  160813. "I2": "input",
  160814. "I3": "input",
  160815. "O": "output"
  160816. },
  160817. "connections": {
  160818. "I0": [ "0" ],
  160819. "I1": [ 6569 ],
  160820. "I2": [ 6686 ],
  160821. "I3": [ 6689 ],
  160822. "O": [ 6720 ]
  160823. }
  160824. },
  160825. "vid_I.pp_data_load_2_SB_LUT4_I3_18": {
  160826. "hide_name": 0,
  160827. "type": "SB_LUT4",
  160828. "parameters": {
  160829. "LUT_INIT": "1100110011110000"
  160830. },
  160831. "attributes": {
  160832. "module_not_derived": "00000000000000000000000000000001",
  160833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160834. },
  160835. "port_directions": {
  160836. "I0": "input",
  160837. "I1": "input",
  160838. "I2": "input",
  160839. "I3": "input",
  160840. "O": "output"
  160841. },
  160842. "connections": {
  160843. "I0": [ "0" ],
  160844. "I1": [ 6570 ],
  160845. "I2": [ 6685 ],
  160846. "I3": [ 6689 ],
  160847. "O": [ 6718 ]
  160848. }
  160849. },
  160850. "vid_I.pp_data_load_2_SB_LUT4_I3_19": {
  160851. "hide_name": 0,
  160852. "type": "SB_LUT4",
  160853. "parameters": {
  160854. "LUT_INIT": "1100110011110000"
  160855. },
  160856. "attributes": {
  160857. "module_not_derived": "00000000000000000000000000000001",
  160858. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160859. },
  160860. "port_directions": {
  160861. "I0": "input",
  160862. "I1": "input",
  160863. "I2": "input",
  160864. "I3": "input",
  160865. "O": "output"
  160866. },
  160867. "connections": {
  160868. "I0": [ "0" ],
  160869. "I1": [ 6571 ],
  160870. "I2": [ 6684 ],
  160871. "I3": [ 6689 ],
  160872. "O": [ 6716 ]
  160873. }
  160874. },
  160875. "vid_I.pp_data_load_2_SB_LUT4_I3_2": {
  160876. "hide_name": 0,
  160877. "type": "SB_LUT4",
  160878. "parameters": {
  160879. "LUT_INIT": "1100110011110000"
  160880. },
  160881. "attributes": {
  160882. "module_not_derived": "00000000000000000000000000000001",
  160883. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160884. },
  160885. "port_directions": {
  160886. "I0": "input",
  160887. "I1": "input",
  160888. "I2": "input",
  160889. "I3": "input",
  160890. "O": "output"
  160891. },
  160892. "connections": {
  160893. "I0": [ "0" ],
  160894. "I1": [ 6491 ],
  160895. "I2": [ 6699 ],
  160896. "I3": [ 6689 ],
  160897. "O": [ 6712 ]
  160898. }
  160899. },
  160900. "vid_I.pp_data_load_2_SB_LUT4_I3_20": {
  160901. "hide_name": 0,
  160902. "type": "SB_LUT4",
  160903. "parameters": {
  160904. "LUT_INIT": "1100110011110000"
  160905. },
  160906. "attributes": {
  160907. "module_not_derived": "00000000000000000000000000000001",
  160908. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160909. },
  160910. "port_directions": {
  160911. "I0": "input",
  160912. "I1": "input",
  160913. "I2": "input",
  160914. "I3": "input",
  160915. "O": "output"
  160916. },
  160917. "connections": {
  160918. "I0": [ "0" ],
  160919. "I1": [ 6572 ],
  160920. "I2": [ 6683 ],
  160921. "I3": [ 6689 ],
  160922. "O": [ 6710 ]
  160923. }
  160924. },
  160925. "vid_I.pp_data_load_2_SB_LUT4_I3_21": {
  160926. "hide_name": 0,
  160927. "type": "SB_LUT4",
  160928. "parameters": {
  160929. "LUT_INIT": "1100110011110000"
  160930. },
  160931. "attributes": {
  160932. "module_not_derived": "00000000000000000000000000000001",
  160933. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160934. },
  160935. "port_directions": {
  160936. "I0": "input",
  160937. "I1": "input",
  160938. "I2": "input",
  160939. "I3": "input",
  160940. "O": "output"
  160941. },
  160942. "connections": {
  160943. "I0": [ "0" ],
  160944. "I1": [ 6573 ],
  160945. "I2": [ 6682 ],
  160946. "I3": [ 6689 ],
  160947. "O": [ 6692 ]
  160948. }
  160949. },
  160950. "vid_I.pp_data_load_2_SB_LUT4_I3_22": {
  160951. "hide_name": 0,
  160952. "type": "SB_LUT4",
  160953. "parameters": {
  160954. "LUT_INIT": "1100110011110000"
  160955. },
  160956. "attributes": {
  160957. "module_not_derived": "00000000000000000000000000000001",
  160958. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160959. },
  160960. "port_directions": {
  160961. "I0": "input",
  160962. "I1": "input",
  160963. "I2": "input",
  160964. "I3": "input",
  160965. "O": "output"
  160966. },
  160967. "connections": {
  160968. "I0": [ "0" ],
  160969. "I1": [ 6574 ],
  160970. "I2": [ 6680 ],
  160971. "I3": [ 6689 ],
  160972. "O": [ 6690 ]
  160973. }
  160974. },
  160975. "vid_I.pp_data_load_2_SB_LUT4_I3_23": {
  160976. "hide_name": 0,
  160977. "type": "SB_LUT4",
  160978. "parameters": {
  160979. "LUT_INIT": "1100110011110000"
  160980. },
  160981. "attributes": {
  160982. "module_not_derived": "00000000000000000000000000000001",
  160983. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  160984. },
  160985. "port_directions": {
  160986. "I0": "input",
  160987. "I1": "input",
  160988. "I2": "input",
  160989. "I3": "input",
  160990. "O": "output"
  160991. },
  160992. "connections": {
  160993. "I0": [ "0" ],
  160994. "I1": [ 6489 ],
  160995. "I2": [ 6705 ],
  160996. "I3": [ 6689 ],
  160997. "O": [ 6715 ]
  160998. }
  160999. },
  161000. "vid_I.pp_data_load_2_SB_LUT4_I3_3": {
  161001. "hide_name": 0,
  161002. "type": "SB_LUT4",
  161003. "parameters": {
  161004. "LUT_INIT": "1100110011110000"
  161005. },
  161006. "attributes": {
  161007. "module_not_derived": "00000000000000000000000000000001",
  161008. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161009. },
  161010. "port_directions": {
  161011. "I0": "input",
  161012. "I1": "input",
  161013. "I2": "input",
  161014. "I3": "input",
  161015. "O": "output"
  161016. },
  161017. "connections": {
  161018. "I0": [ "0" ],
  161019. "I1": [ 6493 ],
  161020. "I2": [ 6697 ],
  161021. "I3": [ 6689 ],
  161022. "O": [ 6709 ]
  161023. }
  161024. },
  161025. "vid_I.pp_data_load_2_SB_LUT4_I3_4": {
  161026. "hide_name": 0,
  161027. "type": "SB_LUT4",
  161028. "parameters": {
  161029. "LUT_INIT": "1100110011110000"
  161030. },
  161031. "attributes": {
  161032. "module_not_derived": "00000000000000000000000000000001",
  161033. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161034. },
  161035. "port_directions": {
  161036. "I0": "input",
  161037. "I1": "input",
  161038. "I2": "input",
  161039. "I3": "input",
  161040. "O": "output"
  161041. },
  161042. "connections": {
  161043. "I0": [ "0" ],
  161044. "I1": [ 6495 ],
  161045. "I2": [ 6695 ],
  161046. "I3": [ 6689 ],
  161047. "O": [ 6708 ]
  161048. }
  161049. },
  161050. "vid_I.pp_data_load_2_SB_LUT4_I3_5": {
  161051. "hide_name": 0,
  161052. "type": "SB_LUT4",
  161053. "parameters": {
  161054. "LUT_INIT": "1100110011110000"
  161055. },
  161056. "attributes": {
  161057. "module_not_derived": "00000000000000000000000000000001",
  161058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161059. },
  161060. "port_directions": {
  161061. "I0": "input",
  161062. "I1": "input",
  161063. "I2": "input",
  161064. "I3": "input",
  161065. "O": "output"
  161066. },
  161067. "connections": {
  161068. "I0": [ "0" ],
  161069. "I1": [ 6497 ],
  161070. "I2": [ 6729 ],
  161071. "I3": [ 6689 ],
  161072. "O": [ 6707 ]
  161073. }
  161074. },
  161075. "vid_I.pp_data_load_2_SB_LUT4_I3_6": {
  161076. "hide_name": 0,
  161077. "type": "SB_LUT4",
  161078. "parameters": {
  161079. "LUT_INIT": "1100110011110000"
  161080. },
  161081. "attributes": {
  161082. "module_not_derived": "00000000000000000000000000000001",
  161083. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161084. },
  161085. "port_directions": {
  161086. "I0": "input",
  161087. "I1": "input",
  161088. "I2": "input",
  161089. "I3": "input",
  161090. "O": "output"
  161091. },
  161092. "connections": {
  161093. "I0": [ "0" ],
  161094. "I1": [ 6499 ],
  161095. "I2": [ 6727 ],
  161096. "I3": [ 6689 ],
  161097. "O": [ 6706 ]
  161098. }
  161099. },
  161100. "vid_I.pp_data_load_2_SB_LUT4_I3_7": {
  161101. "hide_name": 0,
  161102. "type": "SB_LUT4",
  161103. "parameters": {
  161104. "LUT_INIT": "1100110011110000"
  161105. },
  161106. "attributes": {
  161107. "module_not_derived": "00000000000000000000000000000001",
  161108. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161109. },
  161110. "port_directions": {
  161111. "I0": "input",
  161112. "I1": "input",
  161113. "I2": "input",
  161114. "I3": "input",
  161115. "O": "output"
  161116. },
  161117. "connections": {
  161118. "I0": [ "0" ],
  161119. "I1": [ 6501 ],
  161120. "I2": [ 6725 ],
  161121. "I3": [ 6689 ],
  161122. "O": [ 6704 ]
  161123. }
  161124. },
  161125. "vid_I.pp_data_load_2_SB_LUT4_I3_8": {
  161126. "hide_name": 0,
  161127. "type": "SB_LUT4",
  161128. "parameters": {
  161129. "LUT_INIT": "1100110011110000"
  161130. },
  161131. "attributes": {
  161132. "module_not_derived": "00000000000000000000000000000001",
  161133. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161134. },
  161135. "port_directions": {
  161136. "I0": "input",
  161137. "I1": "input",
  161138. "I2": "input",
  161139. "I3": "input",
  161140. "O": "output"
  161141. },
  161142. "connections": {
  161143. "I0": [ "0" ],
  161144. "I1": [ 6503 ],
  161145. "I2": [ 6723 ],
  161146. "I3": [ 6689 ],
  161147. "O": [ 6702 ]
  161148. }
  161149. },
  161150. "vid_I.pp_data_load_2_SB_LUT4_I3_9": {
  161151. "hide_name": 0,
  161152. "type": "SB_LUT4",
  161153. "parameters": {
  161154. "LUT_INIT": "1100110011110000"
  161155. },
  161156. "attributes": {
  161157. "module_not_derived": "00000000000000000000000000000001",
  161158. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161159. },
  161160. "port_directions": {
  161161. "I0": "input",
  161162. "I1": "input",
  161163. "I2": "input",
  161164. "I3": "input",
  161165. "O": "output"
  161166. },
  161167. "connections": {
  161168. "I0": [ "0" ],
  161169. "I1": [ 6505 ],
  161170. "I2": [ 6721 ],
  161171. "I3": [ 6689 ],
  161172. "O": [ 6700 ]
  161173. }
  161174. },
  161175. "vid_I.pp_xdbl_1_SB_DFF_Q": {
  161176. "hide_name": 0,
  161177. "type": "SB_DFF",
  161178. "parameters": {
  161179. },
  161180. "attributes": {
  161181. "module_not_derived": "00000000000000000000000000000001",
  161182. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:224.2-227.5|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  161183. },
  161184. "port_directions": {
  161185. "C": "input",
  161186. "D": "input",
  161187. "Q": "output"
  161188. },
  161189. "connections": {
  161190. "C": [ 42 ],
  161191. "D": [ 6730 ],
  161192. "Q": [ 6582 ]
  161193. }
  161194. },
  161195. "vid_I.pp_xdbl_1_SB_DFF_Q_D_SB_LUT4_O": {
  161196. "hide_name": 0,
  161197. "type": "SB_LUT4",
  161198. "parameters": {
  161199. "LUT_INIT": "0000000000001111"
  161200. },
  161201. "attributes": {
  161202. "module_not_derived": "00000000000000000000000000000001",
  161203. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  161204. },
  161205. "port_directions": {
  161206. "I0": "input",
  161207. "I1": "input",
  161208. "I2": "input",
  161209. "I3": "input",
  161210. "O": "output"
  161211. },
  161212. "connections": {
  161213. "I0": [ "0" ],
  161214. "I1": [ "0" ],
  161215. "I2": [ 6582 ],
  161216. "I3": [ 6611 ],
  161217. "O": [ 6730 ]
  161218. }
  161219. },
  161220. "vid_I.pp_ydbl_1_SB_CARRY_I1": {
  161221. "hide_name": 0,
  161222. "type": "SB_CARRY",
  161223. "parameters": {
  161224. },
  161225. "attributes": {
  161226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161227. },
  161228. "port_directions": {
  161229. "CI": "input",
  161230. "CO": "output",
  161231. "I0": "input",
  161232. "I1": "input"
  161233. },
  161234. "connections": {
  161235. "CI": [ 6731 ],
  161236. "CO": [ 6732 ],
  161237. "I0": [ 6627 ],
  161238. "I1": [ 6733 ]
  161239. }
  161240. },
  161241. "vid_I.pp_ydbl_1_SB_CARRY_I1_1": {
  161242. "hide_name": 0,
  161243. "type": "SB_CARRY",
  161244. "parameters": {
  161245. },
  161246. "attributes": {
  161247. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161248. },
  161249. "port_directions": {
  161250. "CI": "input",
  161251. "CO": "output",
  161252. "I0": "input",
  161253. "I1": "input"
  161254. },
  161255. "connections": {
  161256. "CI": [ "0" ],
  161257. "CO": [ 6734 ],
  161258. "I0": [ 6631 ],
  161259. "I1": [ 6733 ]
  161260. }
  161261. },
  161262. "vid_I.pp_ydbl_1_SB_CARRY_I1_1_CO_SB_CARRY_CI": {
  161263. "hide_name": 0,
  161264. "type": "SB_CARRY",
  161265. "parameters": {
  161266. },
  161267. "attributes": {
  161268. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161269. },
  161270. "port_directions": {
  161271. "CI": "input",
  161272. "CO": "output",
  161273. "I0": "input",
  161274. "I1": "input"
  161275. },
  161276. "connections": {
  161277. "CI": [ 6734 ],
  161278. "CO": [ 6731 ],
  161279. "I0": [ 6629 ],
  161280. "I1": [ "0" ]
  161281. }
  161282. },
  161283. "vid_I.pp_ydbl_1_SB_CARRY_I1_CO_SB_CARRY_CI": {
  161284. "hide_name": 0,
  161285. "type": "SB_CARRY",
  161286. "parameters": {
  161287. },
  161288. "attributes": {
  161289. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161290. },
  161291. "port_directions": {
  161292. "CI": "input",
  161293. "CO": "output",
  161294. "I0": "input",
  161295. "I1": "input"
  161296. },
  161297. "connections": {
  161298. "CI": [ 6732 ],
  161299. "CO": [ 6735 ],
  161300. "I0": [ 6625 ],
  161301. "I1": [ "0" ]
  161302. }
  161303. },
  161304. "vid_I.pp_ydbl_1_SB_DFFESR_Q": {
  161305. "hide_name": 0,
  161306. "type": "SB_DFFESR",
  161307. "parameters": {
  161308. },
  161309. "attributes": {
  161310. "module_not_derived": "00000000000000000000000000000001",
  161311. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  161312. },
  161313. "port_directions": {
  161314. "C": "input",
  161315. "D": "input",
  161316. "E": "input",
  161317. "Q": "output",
  161318. "R": "input"
  161319. },
  161320. "connections": {
  161321. "C": [ 42 ],
  161322. "D": [ 6736 ],
  161323. "E": [ 6611 ],
  161324. "Q": [ 6733 ],
  161325. "R": [ 6613 ]
  161326. }
  161327. },
  161328. "vid_I.pp_ydbl_1_SB_DFFESR_Q_D_SB_LUT4_O": {
  161329. "hide_name": 0,
  161330. "type": "SB_LUT4",
  161331. "parameters": {
  161332. "LUT_INIT": "0000000000111111"
  161333. },
  161334. "attributes": {
  161335. "module_not_derived": "00000000000000000000000000000001",
  161336. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161337. },
  161338. "port_directions": {
  161339. "I0": "input",
  161340. "I1": "input",
  161341. "I2": "input",
  161342. "I3": "input",
  161343. "O": "output"
  161344. },
  161345. "connections": {
  161346. "I0": [ "0" ],
  161347. "I1": [ 6737 ],
  161348. "I2": [ 6738 ],
  161349. "I3": [ 6739 ],
  161350. "O": [ 6740 ]
  161351. }
  161352. },
  161353. "vid_I.pp_ydbl_1_SB_DFFESR_Q_D_SB_LUT4_O_1": {
  161354. "hide_name": 0,
  161355. "type": "SB_LUT4",
  161356. "parameters": {
  161357. "LUT_INIT": "0100010000110001"
  161358. },
  161359. "attributes": {
  161360. "module_not_derived": "00000000000000000000000000000001",
  161361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161362. },
  161363. "port_directions": {
  161364. "I0": "input",
  161365. "I1": "input",
  161366. "I2": "input",
  161367. "I3": "input",
  161368. "O": "output"
  161369. },
  161370. "connections": {
  161371. "I0": [ 6737 ],
  161372. "I1": [ 6738 ],
  161373. "I2": [ 6741 ],
  161374. "I3": [ 6739 ],
  161375. "O": [ 6736 ]
  161376. }
  161377. },
  161378. "vid_I.pp_ydbl_1_SB_DFFESR_Q_D_SB_LUT4_O_2": {
  161379. "hide_name": 0,
  161380. "type": "SB_LUT4",
  161381. "parameters": {
  161382. "LUT_INIT": "0100001000100010"
  161383. },
  161384. "attributes": {
  161385. "module_not_derived": "00000000000000000000000000000001",
  161386. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161387. },
  161388. "port_directions": {
  161389. "I0": "input",
  161390. "I1": "input",
  161391. "I2": "input",
  161392. "I3": "input",
  161393. "O": "output"
  161394. },
  161395. "connections": {
  161396. "I0": [ 6737 ],
  161397. "I1": [ 6738 ],
  161398. "I2": [ 6741 ],
  161399. "I3": [ 6739 ],
  161400. "O": [ 6742 ]
  161401. }
  161402. },
  161403. "vid_I.pp_ydbl_1_SB_DFFESR_Q_D_SB_LUT4_O_3": {
  161404. "hide_name": 0,
  161405. "type": "SB_LUT4",
  161406. "parameters": {
  161407. "LUT_INIT": "0000011101110000"
  161408. },
  161409. "attributes": {
  161410. "module_not_derived": "00000000000000000000000000000001",
  161411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161412. },
  161413. "port_directions": {
  161414. "I0": "input",
  161415. "I1": "input",
  161416. "I2": "input",
  161417. "I3": "input",
  161418. "O": "output"
  161419. },
  161420. "connections": {
  161421. "I0": [ 6737 ],
  161422. "I1": [ 6738 ],
  161423. "I2": [ 6741 ],
  161424. "I3": [ 6739 ],
  161425. "O": [ 6743 ]
  161426. }
  161427. },
  161428. "vid_I.pp_ydbl_1_SB_LUT4_I2": {
  161429. "hide_name": 0,
  161430. "type": "SB_LUT4",
  161431. "parameters": {
  161432. "LUT_INIT": "0110100110010110"
  161433. },
  161434. "attributes": {
  161435. "module_not_derived": "00000000000000000000000000000001",
  161436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161437. },
  161438. "port_directions": {
  161439. "I0": "input",
  161440. "I1": "input",
  161441. "I2": "input",
  161442. "I3": "input",
  161443. "O": "output"
  161444. },
  161445. "connections": {
  161446. "I0": [ "0" ],
  161447. "I1": [ 6631 ],
  161448. "I2": [ 6733 ],
  161449. "I3": [ "0" ],
  161450. "O": [ 6630 ]
  161451. }
  161452. },
  161453. "vid_I.pp_ydbl_1_SB_LUT4_I2_1": {
  161454. "hide_name": 0,
  161455. "type": "SB_LUT4",
  161456. "parameters": {
  161457. "LUT_INIT": "0110100110010110"
  161458. },
  161459. "attributes": {
  161460. "module_not_derived": "00000000000000000000000000000001",
  161461. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161462. },
  161463. "port_directions": {
  161464. "I0": "input",
  161465. "I1": "input",
  161466. "I2": "input",
  161467. "I3": "input",
  161468. "O": "output"
  161469. },
  161470. "connections": {
  161471. "I0": [ "0" ],
  161472. "I1": [ 6627 ],
  161473. "I2": [ 6733 ],
  161474. "I3": [ 6731 ],
  161475. "O": [ 6626 ]
  161476. }
  161477. },
  161478. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O": {
  161479. "hide_name": 0,
  161480. "type": "SB_LUT4",
  161481. "parameters": {
  161482. "LUT_INIT": "0110100110010110"
  161483. },
  161484. "attributes": {
  161485. "module_not_derived": "00000000000000000000000000000001",
  161486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161487. },
  161488. "port_directions": {
  161489. "I0": "input",
  161490. "I1": "input",
  161491. "I2": "input",
  161492. "I3": "input",
  161493. "O": "output"
  161494. },
  161495. "connections": {
  161496. "I0": [ "0" ],
  161497. "I1": [ 6629 ],
  161498. "I2": [ "0" ],
  161499. "I3": [ 6734 ],
  161500. "O": [ 6628 ]
  161501. }
  161502. },
  161503. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_1": {
  161504. "hide_name": 0,
  161505. "type": "SB_LUT4",
  161506. "parameters": {
  161507. "LUT_INIT": "0110100110010110"
  161508. },
  161509. "attributes": {
  161510. "module_not_derived": "00000000000000000000000000000001",
  161511. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161512. },
  161513. "port_directions": {
  161514. "I0": "input",
  161515. "I1": "input",
  161516. "I2": "input",
  161517. "I3": "input",
  161518. "O": "output"
  161519. },
  161520. "connections": {
  161521. "I0": [ "0" ],
  161522. "I1": [ 6625 ],
  161523. "I2": [ "0" ],
  161524. "I3": [ 6732 ],
  161525. "O": [ 6624 ]
  161526. }
  161527. },
  161528. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_2": {
  161529. "hide_name": 0,
  161530. "type": "SB_LUT4",
  161531. "parameters": {
  161532. "LUT_INIT": "0110100110010110"
  161533. },
  161534. "attributes": {
  161535. "module_not_derived": "00000000000000000000000000000001",
  161536. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161537. },
  161538. "port_directions": {
  161539. "I0": "input",
  161540. "I1": "input",
  161541. "I2": "input",
  161542. "I3": "input",
  161543. "O": "output"
  161544. },
  161545. "connections": {
  161546. "I0": [ "0" ],
  161547. "I1": [ 6623 ],
  161548. "I2": [ "0" ],
  161549. "I3": [ 6735 ],
  161550. "O": [ 6622 ]
  161551. }
  161552. },
  161553. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_3": {
  161554. "hide_name": 0,
  161555. "type": "SB_LUT4",
  161556. "parameters": {
  161557. "LUT_INIT": "0110100110010110"
  161558. },
  161559. "attributes": {
  161560. "module_not_derived": "00000000000000000000000000000001",
  161561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161562. },
  161563. "port_directions": {
  161564. "I0": "input",
  161565. "I1": "input",
  161566. "I2": "input",
  161567. "I3": "input",
  161568. "O": "output"
  161569. },
  161570. "connections": {
  161571. "I0": [ "0" ],
  161572. "I1": [ 6621 ],
  161573. "I2": [ "0" ],
  161574. "I3": [ 6744 ],
  161575. "O": [ 6620 ]
  161576. }
  161577. },
  161578. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  161579. "hide_name": 0,
  161580. "type": "SB_CARRY",
  161581. "parameters": {
  161582. },
  161583. "attributes": {
  161584. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161585. },
  161586. "port_directions": {
  161587. "CI": "input",
  161588. "CO": "output",
  161589. "I0": "input",
  161590. "I1": "input"
  161591. },
  161592. "connections": {
  161593. "CI": [ 6735 ],
  161594. "CO": [ 6744 ],
  161595. "I0": [ 6623 ],
  161596. "I1": [ "0" ]
  161597. }
  161598. },
  161599. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_4": {
  161600. "hide_name": 0,
  161601. "type": "SB_LUT4",
  161602. "parameters": {
  161603. "LUT_INIT": "0110100110010110"
  161604. },
  161605. "attributes": {
  161606. "module_not_derived": "00000000000000000000000000000001",
  161607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161608. },
  161609. "port_directions": {
  161610. "I0": "input",
  161611. "I1": "input",
  161612. "I2": "input",
  161613. "I3": "input",
  161614. "O": "output"
  161615. },
  161616. "connections": {
  161617. "I0": [ "0" ],
  161618. "I1": [ 6619 ],
  161619. "I2": [ "0" ],
  161620. "I3": [ 6745 ],
  161621. "O": [ 6618 ]
  161622. }
  161623. },
  161624. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  161625. "hide_name": 0,
  161626. "type": "SB_CARRY",
  161627. "parameters": {
  161628. },
  161629. "attributes": {
  161630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161631. },
  161632. "port_directions": {
  161633. "CI": "input",
  161634. "CO": "output",
  161635. "I0": "input",
  161636. "I1": "input"
  161637. },
  161638. "connections": {
  161639. "CI": [ 6744 ],
  161640. "CO": [ 6745 ],
  161641. "I0": [ 6621 ],
  161642. "I1": [ "0" ]
  161643. }
  161644. },
  161645. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_5": {
  161646. "hide_name": 0,
  161647. "type": "SB_LUT4",
  161648. "parameters": {
  161649. "LUT_INIT": "0110100110010110"
  161650. },
  161651. "attributes": {
  161652. "module_not_derived": "00000000000000000000000000000001",
  161653. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161654. },
  161655. "port_directions": {
  161656. "I0": "input",
  161657. "I1": "input",
  161658. "I2": "input",
  161659. "I3": "input",
  161660. "O": "output"
  161661. },
  161662. "connections": {
  161663. "I0": [ "0" ],
  161664. "I1": [ 6617 ],
  161665. "I2": [ "0" ],
  161666. "I3": [ 6746 ],
  161667. "O": [ 6616 ]
  161668. }
  161669. },
  161670. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  161671. "hide_name": 0,
  161672. "type": "SB_CARRY",
  161673. "parameters": {
  161674. },
  161675. "attributes": {
  161676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161677. },
  161678. "port_directions": {
  161679. "CI": "input",
  161680. "CO": "output",
  161681. "I0": "input",
  161682. "I1": "input"
  161683. },
  161684. "connections": {
  161685. "CI": [ 6745 ],
  161686. "CO": [ 6746 ],
  161687. "I0": [ 6619 ],
  161688. "I1": [ "0" ]
  161689. }
  161690. },
  161691. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_6": {
  161692. "hide_name": 0,
  161693. "type": "SB_LUT4",
  161694. "parameters": {
  161695. "LUT_INIT": "0110100110010110"
  161696. },
  161697. "attributes": {
  161698. "module_not_derived": "00000000000000000000000000000001",
  161699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161700. },
  161701. "port_directions": {
  161702. "I0": "input",
  161703. "I1": "input",
  161704. "I2": "input",
  161705. "I3": "input",
  161706. "O": "output"
  161707. },
  161708. "connections": {
  161709. "I0": [ "0" ],
  161710. "I1": [ 6615 ],
  161711. "I2": [ "0" ],
  161712. "I3": [ 6747 ],
  161713. "O": [ 6614 ]
  161714. }
  161715. },
  161716. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  161717. "hide_name": 0,
  161718. "type": "SB_CARRY",
  161719. "parameters": {
  161720. },
  161721. "attributes": {
  161722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161723. },
  161724. "port_directions": {
  161725. "CI": "input",
  161726. "CO": "output",
  161727. "I0": "input",
  161728. "I1": "input"
  161729. },
  161730. "connections": {
  161731. "CI": [ 6746 ],
  161732. "CO": [ 6747 ],
  161733. "I0": [ 6617 ],
  161734. "I1": [ "0" ]
  161735. }
  161736. },
  161737. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_7": {
  161738. "hide_name": 0,
  161739. "type": "SB_LUT4",
  161740. "parameters": {
  161741. "LUT_INIT": "0110100110010110"
  161742. },
  161743. "attributes": {
  161744. "module_not_derived": "00000000000000000000000000000001",
  161745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  161746. },
  161747. "port_directions": {
  161748. "I0": "input",
  161749. "I1": "input",
  161750. "I2": "input",
  161751. "I3": "input",
  161752. "O": "output"
  161753. },
  161754. "connections": {
  161755. "I0": [ "0" ],
  161756. "I1": [ 6612 ],
  161757. "I2": [ "0" ],
  161758. "I3": [ 6748 ],
  161759. "O": [ 6610 ]
  161760. }
  161761. },
  161762. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_7_I3_SB_CARRY_CO": {
  161763. "hide_name": 0,
  161764. "type": "SB_CARRY",
  161765. "parameters": {
  161766. },
  161767. "attributes": {
  161768. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  161769. },
  161770. "port_directions": {
  161771. "CI": "input",
  161772. "CO": "output",
  161773. "I0": "input",
  161774. "I1": "input"
  161775. },
  161776. "connections": {
  161777. "CI": [ 6747 ],
  161778. "CO": [ 6748 ],
  161779. "I0": [ 6615 ],
  161780. "I1": [ "0" ]
  161781. }
  161782. },
  161783. "vid_I.pp_yscale_state_SB_DFFESR_Q": {
  161784. "hide_name": 0,
  161785. "type": "SB_DFFESR",
  161786. "parameters": {
  161787. },
  161788. "attributes": {
  161789. "module_not_derived": "00000000000000000000000000000001",
  161790. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  161791. },
  161792. "port_directions": {
  161793. "C": "input",
  161794. "D": "input",
  161795. "E": "input",
  161796. "Q": "output",
  161797. "R": "input"
  161798. },
  161799. "connections": {
  161800. "C": [ 42 ],
  161801. "D": [ 6742 ],
  161802. "E": [ 6611 ],
  161803. "Q": [ 6737 ],
  161804. "R": [ 6613 ]
  161805. }
  161806. },
  161807. "vid_I.pp_yscale_state_SB_DFFESR_Q_1": {
  161808. "hide_name": 0,
  161809. "type": "SB_DFFESR",
  161810. "parameters": {
  161811. },
  161812. "attributes": {
  161813. "module_not_derived": "00000000000000000000000000000001",
  161814. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  161815. },
  161816. "port_directions": {
  161817. "C": "input",
  161818. "D": "input",
  161819. "E": "input",
  161820. "Q": "output",
  161821. "R": "input"
  161822. },
  161823. "connections": {
  161824. "C": [ 42 ],
  161825. "D": [ 6743 ],
  161826. "E": [ 6611 ],
  161827. "Q": [ 6741 ],
  161828. "R": [ 6613 ]
  161829. }
  161830. },
  161831. "vid_I.pp_yscale_state_SB_DFFESR_Q_2": {
  161832. "hide_name": 0,
  161833. "type": "SB_DFFESR",
  161834. "parameters": {
  161835. },
  161836. "attributes": {
  161837. "module_not_derived": "00000000000000000000000000000001",
  161838. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  161839. },
  161840. "port_directions": {
  161841. "C": "input",
  161842. "D": "input",
  161843. "E": "input",
  161844. "Q": "output",
  161845. "R": "input"
  161846. },
  161847. "connections": {
  161848. "C": [ 42 ],
  161849. "D": [ 6740 ],
  161850. "E": [ 6611 ],
  161851. "Q": [ 6739 ],
  161852. "R": [ 6613 ]
  161853. }
  161854. },
  161855. "vid_I.pp_yscale_state_SB_DFFESR_Q_3": {
  161856. "hide_name": 0,
  161857. "type": "SB_DFFESR",
  161858. "parameters": {
  161859. },
  161860. "attributes": {
  161861. "module_not_derived": "00000000000000000000000000000001",
  161862. "src": "/usr/bin/../share/yosys/ice40/ff_map.v:24.66-24.119"
  161863. },
  161864. "port_directions": {
  161865. "C": "input",
  161866. "D": "input",
  161867. "E": "input",
  161868. "Q": "output",
  161869. "R": "input"
  161870. },
  161871. "connections": {
  161872. "C": [ 42 ],
  161873. "D": [ 6749 ],
  161874. "E": [ 6611 ],
  161875. "Q": [ 6738 ],
  161876. "R": [ 6750 ]
  161877. }
  161878. },
  161879. "vid_I.pp_yscale_state_SB_DFFESR_Q_3_D_SB_LUT4_O": {
  161880. "hide_name": 0,
  161881. "type": "SB_LUT4",
  161882. "parameters": {
  161883. "LUT_INIT": "0011110011001100"
  161884. },
  161885. "attributes": {
  161886. "module_not_derived": "00000000000000000000000000000001",
  161887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161888. },
  161889. "port_directions": {
  161890. "I0": "input",
  161891. "I1": "input",
  161892. "I2": "input",
  161893. "I3": "input",
  161894. "O": "output"
  161895. },
  161896. "connections": {
  161897. "I0": [ "0" ],
  161898. "I1": [ 6738 ],
  161899. "I2": [ 6741 ],
  161900. "I3": [ 6739 ],
  161901. "O": [ 6749 ]
  161902. }
  161903. },
  161904. "vid_I.pp_yscale_state_SB_DFFESR_Q_3_R_SB_LUT4_O": {
  161905. "hide_name": 0,
  161906. "type": "SB_LUT4",
  161907. "parameters": {
  161908. "LUT_INIT": "1111111111110000"
  161909. },
  161910. "attributes": {
  161911. "module_not_derived": "00000000000000000000000000000001",
  161912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  161913. },
  161914. "port_directions": {
  161915. "I0": "input",
  161916. "I1": "input",
  161917. "I2": "input",
  161918. "I3": "input",
  161919. "O": "output"
  161920. },
  161921. "connections": {
  161922. "I0": [ "0" ],
  161923. "I1": [ "0" ],
  161924. "I2": [ 6737 ],
  161925. "I3": [ 6613 ],
  161926. "O": [ 6750 ]
  161927. }
  161928. },
  161929. "vid_I.tgen_I.h_last_SB_DFFR_Q": {
  161930. "hide_name": 0,
  161931. "type": "SB_DFFR",
  161932. "parameters": {
  161933. },
  161934. "attributes": {
  161935. "module_not_derived": "00000000000000000000000000000001",
  161936. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  161937. },
  161938. "port_directions": {
  161939. "C": "input",
  161940. "D": "input",
  161941. "Q": "output",
  161942. "R": "input"
  161943. },
  161944. "connections": {
  161945. "C": [ 42 ],
  161946. "D": [ 6751 ],
  161947. "Q": [ 6752 ],
  161948. "R": [ 127 ]
  161949. }
  161950. },
  161951. "vid_I.tgen_I.h_last_SB_LUT4_I3": {
  161952. "hide_name": 0,
  161953. "type": "SB_LUT4",
  161954. "parameters": {
  161955. "LUT_INIT": "0011110011110000"
  161956. },
  161957. "attributes": {
  161958. "module_not_derived": "00000000000000000000000000000001",
  161959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  161960. },
  161961. "port_directions": {
  161962. "I0": "input",
  161963. "I1": "input",
  161964. "I2": "input",
  161965. "I3": "input",
  161966. "O": "output"
  161967. },
  161968. "connections": {
  161969. "I0": [ "0" ],
  161970. "I1": [ 6518 ],
  161971. "I2": [ 6519 ],
  161972. "I3": [ 6752 ],
  161973. "O": [ 6753 ]
  161974. }
  161975. },
  161976. "vid_I.tgen_I.h_last_SB_LUT4_I3_1": {
  161977. "hide_name": 0,
  161978. "type": "SB_LUT4",
  161979. "parameters": {
  161980. "LUT_INIT": "0000111111110000"
  161981. },
  161982. "attributes": {
  161983. "module_not_derived": "00000000000000000000000000000001",
  161984. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  161985. },
  161986. "port_directions": {
  161987. "I0": "input",
  161988. "I1": "input",
  161989. "I2": "input",
  161990. "I3": "input",
  161991. "O": "output"
  161992. },
  161993. "connections": {
  161994. "I0": [ "0" ],
  161995. "I1": [ "0" ],
  161996. "I2": [ 6518 ],
  161997. "I3": [ 6752 ],
  161998. "O": [ 6754 ]
  161999. }
  162000. },
  162001. "vid_I.tgen_I.h_last_SB_LUT4_I3_1_O_SB_DFFR_D": {
  162002. "hide_name": 0,
  162003. "type": "SB_DFFR",
  162004. "parameters": {
  162005. },
  162006. "attributes": {
  162007. "module_not_derived": "00000000000000000000000000000001",
  162008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:102.2-106.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162009. },
  162010. "port_directions": {
  162011. "C": "input",
  162012. "D": "input",
  162013. "Q": "output",
  162014. "R": "input"
  162015. },
  162016. "connections": {
  162017. "C": [ 42 ],
  162018. "D": [ 6754 ],
  162019. "Q": [ 6518 ],
  162020. "R": [ 127 ]
  162021. }
  162022. },
  162023. "vid_I.tgen_I.h_last_SB_LUT4_I3_O_SB_DFFR_D": {
  162024. "hide_name": 0,
  162025. "type": "SB_DFFR",
  162026. "parameters": {
  162027. },
  162028. "attributes": {
  162029. "module_not_derived": "00000000000000000000000000000001",
  162030. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:102.2-106.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162031. },
  162032. "port_directions": {
  162033. "C": "input",
  162034. "D": "input",
  162035. "Q": "output",
  162036. "R": "input"
  162037. },
  162038. "connections": {
  162039. "C": [ 42 ],
  162040. "D": [ 6753 ],
  162041. "Q": [ 6519 ],
  162042. "R": [ 127 ]
  162043. }
  162044. },
  162045. "vid_I.tgen_I.h_mux_SB_LUT4_O": {
  162046. "hide_name": 0,
  162047. "type": "SB_LUT4",
  162048. "parameters": {
  162049. "LUT_INIT": "0010000100010010"
  162050. },
  162051. "attributes": {
  162052. "module_not_derived": "00000000000000000000000000000001",
  162053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162054. },
  162055. "port_directions": {
  162056. "I0": "input",
  162057. "I1": "input",
  162058. "I2": "input",
  162059. "I3": "input",
  162060. "O": "output"
  162061. },
  162062. "connections": {
  162063. "I0": [ "0" ],
  162064. "I1": [ 6752 ],
  162065. "I2": [ "1" ],
  162066. "I3": [ 6755 ],
  162067. "O": [ 6751 ]
  162068. }
  162069. },
  162070. "vid_I.tgen_I.h_mux_SB_LUT4_O_1": {
  162071. "hide_name": 0,
  162072. "type": "SB_LUT4",
  162073. "parameters": {
  162074. "LUT_INIT": "1110101110111110"
  162075. },
  162076. "attributes": {
  162077. "module_not_derived": "00000000000000000000000000000001",
  162078. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162079. },
  162080. "port_directions": {
  162081. "I0": "input",
  162082. "I1": "input",
  162083. "I2": "input",
  162084. "I3": "input",
  162085. "O": "output"
  162086. },
  162087. "connections": {
  162088. "I0": [ 6752 ],
  162089. "I1": [ 6756 ],
  162090. "I2": [ "1" ],
  162091. "I3": [ 6757 ],
  162092. "O": [ 6758 ]
  162093. }
  162094. },
  162095. "vid_I.tgen_I.h_mux_SB_LUT4_O_10": {
  162096. "hide_name": 0,
  162097. "type": "SB_LUT4",
  162098. "parameters": {
  162099. "LUT_INIT": "0000000000001111"
  162100. },
  162101. "attributes": {
  162102. "module_not_derived": "00000000000000000000000000000001",
  162103. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  162104. },
  162105. "port_directions": {
  162106. "I0": "input",
  162107. "I1": "input",
  162108. "I2": "input",
  162109. "I3": "input",
  162110. "O": "output"
  162111. },
  162112. "connections": {
  162113. "I0": [ "0" ],
  162114. "I1": [ "0" ],
  162115. "I2": [ 6752 ],
  162116. "I3": [ 6757 ],
  162117. "O": [ 6759 ]
  162118. }
  162119. },
  162120. "vid_I.tgen_I.h_mux_SB_LUT4_O_1_I1_SB_DFFR_Q": {
  162121. "hide_name": 0,
  162122. "type": "SB_DFFR",
  162123. "parameters": {
  162124. },
  162125. "attributes": {
  162126. "module_not_derived": "00000000000000000000000000000001",
  162127. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162128. },
  162129. "port_directions": {
  162130. "C": "input",
  162131. "D": "input",
  162132. "Q": "output",
  162133. "R": "input"
  162134. },
  162135. "connections": {
  162136. "C": [ 42 ],
  162137. "D": [ 6758 ],
  162138. "Q": [ 6756 ],
  162139. "R": [ 127 ]
  162140. }
  162141. },
  162142. "vid_I.tgen_I.h_mux_SB_LUT4_O_1_I3_SB_DFFR_Q": {
  162143. "hide_name": 0,
  162144. "type": "SB_DFFR",
  162145. "parameters": {
  162146. },
  162147. "attributes": {
  162148. "module_not_derived": "00000000000000000000000000000001",
  162149. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162150. },
  162151. "port_directions": {
  162152. "C": "input",
  162153. "D": "input",
  162154. "Q": "output",
  162155. "R": "input"
  162156. },
  162157. "connections": {
  162158. "C": [ 42 ],
  162159. "D": [ 6759 ],
  162160. "Q": [ 6757 ],
  162161. "R": [ 127 ]
  162162. }
  162163. },
  162164. "vid_I.tgen_I.h_mux_SB_LUT4_O_2": {
  162165. "hide_name": 0,
  162166. "type": "SB_LUT4",
  162167. "parameters": {
  162168. "LUT_INIT": "1110101110111110"
  162169. },
  162170. "attributes": {
  162171. "module_not_derived": "00000000000000000000000000000001",
  162172. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162173. },
  162174. "port_directions": {
  162175. "I0": "input",
  162176. "I1": "input",
  162177. "I2": "input",
  162178. "I3": "input",
  162179. "O": "output"
  162180. },
  162181. "connections": {
  162182. "I0": [ 6752 ],
  162183. "I1": [ 6760 ],
  162184. "I2": [ "1" ],
  162185. "I3": [ 6761 ],
  162186. "O": [ 6762 ]
  162187. }
  162188. },
  162189. "vid_I.tgen_I.h_mux_SB_LUT4_O_2_I1_SB_DFFR_Q": {
  162190. "hide_name": 0,
  162191. "type": "SB_DFFR",
  162192. "parameters": {
  162193. },
  162194. "attributes": {
  162195. "module_not_derived": "00000000000000000000000000000001",
  162196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162197. },
  162198. "port_directions": {
  162199. "C": "input",
  162200. "D": "input",
  162201. "Q": "output",
  162202. "R": "input"
  162203. },
  162204. "connections": {
  162205. "C": [ 42 ],
  162206. "D": [ 6762 ],
  162207. "Q": [ 6760 ],
  162208. "R": [ 127 ]
  162209. }
  162210. },
  162211. "vid_I.tgen_I.h_mux_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  162212. "hide_name": 0,
  162213. "type": "SB_CARRY",
  162214. "parameters": {
  162215. },
  162216. "attributes": {
  162217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162218. },
  162219. "port_directions": {
  162220. "CI": "input",
  162221. "CO": "output",
  162222. "I0": "input",
  162223. "I1": "input"
  162224. },
  162225. "connections": {
  162226. "CI": [ 6757 ],
  162227. "CO": [ 6761 ],
  162228. "I0": [ 6756 ],
  162229. "I1": [ "1" ]
  162230. }
  162231. },
  162232. "vid_I.tgen_I.h_mux_SB_LUT4_O_3": {
  162233. "hide_name": 0,
  162234. "type": "SB_LUT4",
  162235. "parameters": {
  162236. "LUT_INIT": "1110101110111110"
  162237. },
  162238. "attributes": {
  162239. "module_not_derived": "00000000000000000000000000000001",
  162240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162241. },
  162242. "port_directions": {
  162243. "I0": "input",
  162244. "I1": "input",
  162245. "I2": "input",
  162246. "I3": "input",
  162247. "O": "output"
  162248. },
  162249. "connections": {
  162250. "I0": [ 6752 ],
  162251. "I1": [ 6763 ],
  162252. "I2": [ "1" ],
  162253. "I3": [ 6764 ],
  162254. "O": [ 6765 ]
  162255. }
  162256. },
  162257. "vid_I.tgen_I.h_mux_SB_LUT4_O_3_I1_SB_DFFR_Q": {
  162258. "hide_name": 0,
  162259. "type": "SB_DFFR",
  162260. "parameters": {
  162261. },
  162262. "attributes": {
  162263. "module_not_derived": "00000000000000000000000000000001",
  162264. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162265. },
  162266. "port_directions": {
  162267. "C": "input",
  162268. "D": "input",
  162269. "Q": "output",
  162270. "R": "input"
  162271. },
  162272. "connections": {
  162273. "C": [ 42 ],
  162274. "D": [ 6765 ],
  162275. "Q": [ 6763 ],
  162276. "R": [ 127 ]
  162277. }
  162278. },
  162279. "vid_I.tgen_I.h_mux_SB_LUT4_O_3_I3_SB_CARRY_CI": {
  162280. "hide_name": 0,
  162281. "type": "SB_CARRY",
  162282. "parameters": {
  162283. },
  162284. "attributes": {
  162285. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162286. },
  162287. "port_directions": {
  162288. "CI": "input",
  162289. "CO": "output",
  162290. "I0": "input",
  162291. "I1": "input"
  162292. },
  162293. "connections": {
  162294. "CI": [ 6764 ],
  162295. "CO": [ 6766 ],
  162296. "I0": [ 6763 ],
  162297. "I1": [ "1" ]
  162298. }
  162299. },
  162300. "vid_I.tgen_I.h_mux_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  162301. "hide_name": 0,
  162302. "type": "SB_CARRY",
  162303. "parameters": {
  162304. },
  162305. "attributes": {
  162306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162307. },
  162308. "port_directions": {
  162309. "CI": "input",
  162310. "CO": "output",
  162311. "I0": "input",
  162312. "I1": "input"
  162313. },
  162314. "connections": {
  162315. "CI": [ 6761 ],
  162316. "CO": [ 6764 ],
  162317. "I0": [ 6760 ],
  162318. "I1": [ "1" ]
  162319. }
  162320. },
  162321. "vid_I.tgen_I.h_mux_SB_LUT4_O_4": {
  162322. "hide_name": 0,
  162323. "type": "SB_LUT4",
  162324. "parameters": {
  162325. "LUT_INIT": "0100000100010100"
  162326. },
  162327. "attributes": {
  162328. "module_not_derived": "00000000000000000000000000000001",
  162329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162330. },
  162331. "port_directions": {
  162332. "I0": "input",
  162333. "I1": "input",
  162334. "I2": "input",
  162335. "I3": "input",
  162336. "O": "output"
  162337. },
  162338. "connections": {
  162339. "I0": [ 6752 ],
  162340. "I1": [ 6767 ],
  162341. "I2": [ "1" ],
  162342. "I3": [ 6768 ],
  162343. "O": [ 6769 ]
  162344. }
  162345. },
  162346. "vid_I.tgen_I.h_mux_SB_LUT4_O_4_I1_SB_DFFR_Q": {
  162347. "hide_name": 0,
  162348. "type": "SB_DFFR",
  162349. "parameters": {
  162350. },
  162351. "attributes": {
  162352. "module_not_derived": "00000000000000000000000000000001",
  162353. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162354. },
  162355. "port_directions": {
  162356. "C": "input",
  162357. "D": "input",
  162358. "Q": "output",
  162359. "R": "input"
  162360. },
  162361. "connections": {
  162362. "C": [ 42 ],
  162363. "D": [ 6769 ],
  162364. "Q": [ 6767 ],
  162365. "R": [ 127 ]
  162366. }
  162367. },
  162368. "vid_I.tgen_I.h_mux_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  162369. "hide_name": 0,
  162370. "type": "SB_CARRY",
  162371. "parameters": {
  162372. },
  162373. "attributes": {
  162374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162375. },
  162376. "port_directions": {
  162377. "CI": "input",
  162378. "CO": "output",
  162379. "I0": "input",
  162380. "I1": "input"
  162381. },
  162382. "connections": {
  162383. "CI": [ 6770 ],
  162384. "CO": [ 6768 ],
  162385. "I0": [ 6771 ],
  162386. "I1": [ "1" ]
  162387. }
  162388. },
  162389. "vid_I.tgen_I.h_mux_SB_LUT4_O_5": {
  162390. "hide_name": 0,
  162391. "type": "SB_LUT4",
  162392. "parameters": {
  162393. "LUT_INIT": "0100000100010100"
  162394. },
  162395. "attributes": {
  162396. "module_not_derived": "00000000000000000000000000000001",
  162397. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162398. },
  162399. "port_directions": {
  162400. "I0": "input",
  162401. "I1": "input",
  162402. "I2": "input",
  162403. "I3": "input",
  162404. "O": "output"
  162405. },
  162406. "connections": {
  162407. "I0": [ 6752 ],
  162408. "I1": [ 6772 ],
  162409. "I2": [ "1" ],
  162410. "I3": [ 6773 ],
  162411. "O": [ 6774 ]
  162412. }
  162413. },
  162414. "vid_I.tgen_I.h_mux_SB_LUT4_O_5_I1_SB_DFFR_Q": {
  162415. "hide_name": 0,
  162416. "type": "SB_DFFR",
  162417. "parameters": {
  162418. },
  162419. "attributes": {
  162420. "module_not_derived": "00000000000000000000000000000001",
  162421. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162422. },
  162423. "port_directions": {
  162424. "C": "input",
  162425. "D": "input",
  162426. "Q": "output",
  162427. "R": "input"
  162428. },
  162429. "connections": {
  162430. "C": [ 42 ],
  162431. "D": [ 6774 ],
  162432. "Q": [ 6772 ],
  162433. "R": [ 127 ]
  162434. }
  162435. },
  162436. "vid_I.tgen_I.h_mux_SB_LUT4_O_5_I3_SB_CARRY_CI": {
  162437. "hide_name": 0,
  162438. "type": "SB_CARRY",
  162439. "parameters": {
  162440. },
  162441. "attributes": {
  162442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162443. },
  162444. "port_directions": {
  162445. "CI": "input",
  162446. "CO": "output",
  162447. "I0": "input",
  162448. "I1": "input"
  162449. },
  162450. "connections": {
  162451. "CI": [ 6773 ],
  162452. "CO": [ 6775 ],
  162453. "I0": [ 6772 ],
  162454. "I1": [ "1" ]
  162455. }
  162456. },
  162457. "vid_I.tgen_I.h_mux_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  162458. "hide_name": 0,
  162459. "type": "SB_CARRY",
  162460. "parameters": {
  162461. },
  162462. "attributes": {
  162463. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162464. },
  162465. "port_directions": {
  162466. "CI": "input",
  162467. "CO": "output",
  162468. "I0": "input",
  162469. "I1": "input"
  162470. },
  162471. "connections": {
  162472. "CI": [ 6768 ],
  162473. "CO": [ 6773 ],
  162474. "I0": [ 6767 ],
  162475. "I1": [ "1" ]
  162476. }
  162477. },
  162478. "vid_I.tgen_I.h_mux_SB_LUT4_O_6": {
  162479. "hide_name": 0,
  162480. "type": "SB_LUT4",
  162481. "parameters": {
  162482. "LUT_INIT": "0110111101100000"
  162483. },
  162484. "attributes": {
  162485. "module_not_derived": "00000000000000000000000000000001",
  162486. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162487. },
  162488. "port_directions": {
  162489. "I0": "input",
  162490. "I1": "input",
  162491. "I2": "input",
  162492. "I3": "input",
  162493. "O": "output"
  162494. },
  162495. "connections": {
  162496. "I0": [ 6518 ],
  162497. "I1": [ 6519 ],
  162498. "I2": [ 6752 ],
  162499. "I3": [ 6776 ],
  162500. "O": [ 6777 ]
  162501. }
  162502. },
  162503. "vid_I.tgen_I.h_mux_SB_LUT4_O_6_I3_SB_LUT4_O": {
  162504. "hide_name": 0,
  162505. "type": "SB_LUT4",
  162506. "parameters": {
  162507. "LUT_INIT": "0110100110010110"
  162508. },
  162509. "attributes": {
  162510. "module_not_derived": "00000000000000000000000000000001",
  162511. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162512. },
  162513. "port_directions": {
  162514. "I0": "input",
  162515. "I1": "input",
  162516. "I2": "input",
  162517. "I3": "input",
  162518. "O": "output"
  162519. },
  162520. "connections": {
  162521. "I0": [ "0" ],
  162522. "I1": [ 6778 ],
  162523. "I2": [ "1" ],
  162524. "I3": [ 6779 ],
  162525. "O": [ 6776 ]
  162526. }
  162527. },
  162528. "vid_I.tgen_I.h_mux_SB_LUT4_O_6_I3_SB_LUT4_O_I1_SB_DFFR_Q": {
  162529. "hide_name": 0,
  162530. "type": "SB_DFFR",
  162531. "parameters": {
  162532. },
  162533. "attributes": {
  162534. "module_not_derived": "00000000000000000000000000000001",
  162535. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162536. },
  162537. "port_directions": {
  162538. "C": "input",
  162539. "D": "input",
  162540. "Q": "output",
  162541. "R": "input"
  162542. },
  162543. "connections": {
  162544. "C": [ 42 ],
  162545. "D": [ 6777 ],
  162546. "Q": [ 6778 ],
  162547. "R": [ 127 ]
  162548. }
  162549. },
  162550. "vid_I.tgen_I.h_mux_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  162551. "hide_name": 0,
  162552. "type": "SB_CARRY",
  162553. "parameters": {
  162554. },
  162555. "attributes": {
  162556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162557. },
  162558. "port_directions": {
  162559. "CI": "input",
  162560. "CO": "output",
  162561. "I0": "input",
  162562. "I1": "input"
  162563. },
  162564. "connections": {
  162565. "CI": [ 6766 ],
  162566. "CO": [ 6779 ],
  162567. "I0": [ 6780 ],
  162568. "I1": [ "1" ]
  162569. }
  162570. },
  162571. "vid_I.tgen_I.h_mux_SB_LUT4_O_7": {
  162572. "hide_name": 0,
  162573. "type": "SB_LUT4",
  162574. "parameters": {
  162575. "LUT_INIT": "0100111101000000"
  162576. },
  162577. "attributes": {
  162578. "module_not_derived": "00000000000000000000000000000001",
  162579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162580. },
  162581. "port_directions": {
  162582. "I0": "input",
  162583. "I1": "input",
  162584. "I2": "input",
  162585. "I3": "input",
  162586. "O": "output"
  162587. },
  162588. "connections": {
  162589. "I0": [ 6518 ],
  162590. "I1": [ 6519 ],
  162591. "I2": [ 6752 ],
  162592. "I3": [ 6781 ],
  162593. "O": [ 6782 ]
  162594. }
  162595. },
  162596. "vid_I.tgen_I.h_mux_SB_LUT4_O_7_I3_SB_LUT4_O": {
  162597. "hide_name": 0,
  162598. "type": "SB_LUT4",
  162599. "parameters": {
  162600. "LUT_INIT": "0110100110010110"
  162601. },
  162602. "attributes": {
  162603. "module_not_derived": "00000000000000000000000000000001",
  162604. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162605. },
  162606. "port_directions": {
  162607. "I0": "input",
  162608. "I1": "input",
  162609. "I2": "input",
  162610. "I3": "input",
  162611. "O": "output"
  162612. },
  162613. "connections": {
  162614. "I0": [ "0" ],
  162615. "I1": [ 6783 ],
  162616. "I2": [ "1" ],
  162617. "I3": [ 6775 ],
  162618. "O": [ 6781 ]
  162619. }
  162620. },
  162621. "vid_I.tgen_I.h_mux_SB_LUT4_O_8": {
  162622. "hide_name": 0,
  162623. "type": "SB_LUT4",
  162624. "parameters": {
  162625. "LUT_INIT": "0011111100110000"
  162626. },
  162627. "attributes": {
  162628. "module_not_derived": "00000000000000000000000000000001",
  162629. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  162630. },
  162631. "port_directions": {
  162632. "I0": "input",
  162633. "I1": "input",
  162634. "I2": "input",
  162635. "I3": "input",
  162636. "O": "output"
  162637. },
  162638. "connections": {
  162639. "I0": [ "0" ],
  162640. "I1": [ 6518 ],
  162641. "I2": [ 6752 ],
  162642. "I3": [ 6784 ],
  162643. "O": [ 6785 ]
  162644. }
  162645. },
  162646. "vid_I.tgen_I.h_mux_SB_LUT4_O_8_I3_SB_LUT4_O": {
  162647. "hide_name": 0,
  162648. "type": "SB_LUT4",
  162649. "parameters": {
  162650. "LUT_INIT": "0110100110010110"
  162651. },
  162652. "attributes": {
  162653. "module_not_derived": "00000000000000000000000000000001",
  162654. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162655. },
  162656. "port_directions": {
  162657. "I0": "input",
  162658. "I1": "input",
  162659. "I2": "input",
  162660. "I3": "input",
  162661. "O": "output"
  162662. },
  162663. "connections": {
  162664. "I0": [ "0" ],
  162665. "I1": [ 6771 ],
  162666. "I2": [ "1" ],
  162667. "I3": [ 6770 ],
  162668. "O": [ 6784 ]
  162669. }
  162670. },
  162671. "vid_I.tgen_I.h_mux_SB_LUT4_O_8_I3_SB_LUT4_O_I1_SB_DFFR_Q": {
  162672. "hide_name": 0,
  162673. "type": "SB_DFFR",
  162674. "parameters": {
  162675. },
  162676. "attributes": {
  162677. "module_not_derived": "00000000000000000000000000000001",
  162678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162679. },
  162680. "port_directions": {
  162681. "C": "input",
  162682. "D": "input",
  162683. "Q": "output",
  162684. "R": "input"
  162685. },
  162686. "connections": {
  162687. "C": [ 42 ],
  162688. "D": [ 6785 ],
  162689. "Q": [ 6771 ],
  162690. "R": [ 127 ]
  162691. }
  162692. },
  162693. "vid_I.tgen_I.h_mux_SB_LUT4_O_8_I3_SB_LUT4_O_I3_SB_CARRY_CO": {
  162694. "hide_name": 0,
  162695. "type": "SB_CARRY",
  162696. "parameters": {
  162697. },
  162698. "attributes": {
  162699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162700. },
  162701. "port_directions": {
  162702. "CI": "input",
  162703. "CO": "output",
  162704. "I0": "input",
  162705. "I1": "input"
  162706. },
  162707. "connections": {
  162708. "CI": [ 6779 ],
  162709. "CO": [ 6770 ],
  162710. "I0": [ 6778 ],
  162711. "I1": [ "1" ]
  162712. }
  162713. },
  162714. "vid_I.tgen_I.h_mux_SB_LUT4_O_9": {
  162715. "hide_name": 0,
  162716. "type": "SB_LUT4",
  162717. "parameters": {
  162718. "LUT_INIT": "0011111100110000"
  162719. },
  162720. "attributes": {
  162721. "module_not_derived": "00000000000000000000000000000001",
  162722. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  162723. },
  162724. "port_directions": {
  162725. "I0": "input",
  162726. "I1": "input",
  162727. "I2": "input",
  162728. "I3": "input",
  162729. "O": "output"
  162730. },
  162731. "connections": {
  162732. "I0": [ "0" ],
  162733. "I1": [ 6518 ],
  162734. "I2": [ 6752 ],
  162735. "I3": [ 6786 ],
  162736. "O": [ 6787 ]
  162737. }
  162738. },
  162739. "vid_I.tgen_I.h_mux_SB_LUT4_O_9_I3_SB_LUT4_O": {
  162740. "hide_name": 0,
  162741. "type": "SB_LUT4",
  162742. "parameters": {
  162743. "LUT_INIT": "0110100110010110"
  162744. },
  162745. "attributes": {
  162746. "module_not_derived": "00000000000000000000000000000001",
  162747. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162748. },
  162749. "port_directions": {
  162750. "I0": "input",
  162751. "I1": "input",
  162752. "I2": "input",
  162753. "I3": "input",
  162754. "O": "output"
  162755. },
  162756. "connections": {
  162757. "I0": [ "0" ],
  162758. "I1": [ 6780 ],
  162759. "I2": [ "1" ],
  162760. "I3": [ 6766 ],
  162761. "O": [ 6786 ]
  162762. }
  162763. },
  162764. "vid_I.tgen_I.h_mux_SB_LUT4_O_9_I3_SB_LUT4_O_I1_SB_DFFR_Q": {
  162765. "hide_name": 0,
  162766. "type": "SB_DFFR",
  162767. "parameters": {
  162768. },
  162769. "attributes": {
  162770. "module_not_derived": "00000000000000000000000000000001",
  162771. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162772. },
  162773. "port_directions": {
  162774. "C": "input",
  162775. "D": "input",
  162776. "Q": "output",
  162777. "R": "input"
  162778. },
  162779. "connections": {
  162780. "C": [ 42 ],
  162781. "D": [ 6787 ],
  162782. "Q": [ 6780 ],
  162783. "R": [ 127 ]
  162784. }
  162785. },
  162786. "vid_I.tgen_I.h_mux_SB_LUT4_O_I3_SB_CARRY_CO": {
  162787. "hide_name": 0,
  162788. "type": "SB_CARRY",
  162789. "parameters": {
  162790. },
  162791. "attributes": {
  162792. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162793. },
  162794. "port_directions": {
  162795. "CI": "input",
  162796. "CO": "output",
  162797. "I0": "input",
  162798. "I1": "input"
  162799. },
  162800. "connections": {
  162801. "CI": [ 6775 ],
  162802. "CO": [ 6755 ],
  162803. "I0": [ 6783 ],
  162804. "I1": [ "1" ]
  162805. }
  162806. },
  162807. "vid_I.tgen_I.h_mux_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_DFFR_Q": {
  162808. "hide_name": 0,
  162809. "type": "SB_DFFR",
  162810. "parameters": {
  162811. },
  162812. "attributes": {
  162813. "module_not_derived": "00000000000000000000000000000001",
  162814. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:121.2-125.19|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  162815. },
  162816. "port_directions": {
  162817. "C": "input",
  162818. "D": "input",
  162819. "Q": "output",
  162820. "R": "input"
  162821. },
  162822. "connections": {
  162823. "C": [ 42 ],
  162824. "D": [ 6782 ],
  162825. "Q": [ 6783 ],
  162826. "R": [ 127 ]
  162827. }
  162828. },
  162829. "vid_I.tgen_I.v_cnt_I.bit[0].genblk1.dff_I": {
  162830. "hide_name": 0,
  162831. "type": "SB_DFFER",
  162832. "parameters": {
  162833. },
  162834. "attributes": {
  162835. "RBEL_GROUP": " ",
  162836. "RBEL_X": "00000000000000000000000000000000",
  162837. "RBEL_Y": "00000000000000000000000000000000",
  162838. "RBEL_Z": "00000000000000000000000000000000",
  162839. "dont_touch": "true",
  162840. "hdlname": "vid_I tgen_I v_cnt_I bit[0].genblk1.dff_I",
  162841. "module_not_derived": "00000000000000000000000000000001",
  162842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  162843. },
  162844. "port_directions": {
  162845. "C": "input",
  162846. "D": "input",
  162847. "E": "input",
  162848. "Q": "output",
  162849. "R": "input"
  162850. },
  162851. "connections": {
  162852. "C": [ 42 ],
  162853. "D": [ 6788 ],
  162854. "E": [ 6655 ],
  162855. "Q": [ 6789 ],
  162856. "R": [ 127 ]
  162857. }
  162858. },
  162859. "vid_I.tgen_I.v_cnt_I.bit[1].genblk1.dff_I": {
  162860. "hide_name": 0,
  162861. "type": "SB_DFFER",
  162862. "parameters": {
  162863. },
  162864. "attributes": {
  162865. "RBEL_GROUP": " ",
  162866. "RBEL_X": "00000000000000000000000000000000",
  162867. "RBEL_Y": "00000000000000000000000000000000",
  162868. "RBEL_Z": "00000000000000000000000000000001",
  162869. "dont_touch": "true",
  162870. "hdlname": "vid_I tgen_I v_cnt_I bit[1].genblk1.dff_I",
  162871. "module_not_derived": "00000000000000000000000000000001",
  162872. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  162873. },
  162874. "port_directions": {
  162875. "C": "input",
  162876. "D": "input",
  162877. "E": "input",
  162878. "Q": "output",
  162879. "R": "input"
  162880. },
  162881. "connections": {
  162882. "C": [ 42 ],
  162883. "D": [ 6790 ],
  162884. "E": [ 6655 ],
  162885. "Q": [ 6791 ],
  162886. "R": [ 127 ]
  162887. }
  162888. },
  162889. "vid_I.tgen_I.v_cnt_I.bit[1].genblk1.dff_I_Q_SB_CARRY_I0": {
  162890. "hide_name": 0,
  162891. "type": "SB_CARRY",
  162892. "parameters": {
  162893. },
  162894. "attributes": {
  162895. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162896. },
  162897. "port_directions": {
  162898. "CI": "input",
  162899. "CO": "output",
  162900. "I0": "input",
  162901. "I1": "input"
  162902. },
  162903. "connections": {
  162904. "CI": [ 6789 ],
  162905. "CO": [ 6792 ],
  162906. "I0": [ 6791 ],
  162907. "I1": [ "1" ]
  162908. }
  162909. },
  162910. "vid_I.tgen_I.v_cnt_I.bit[2].genblk1.dff_I": {
  162911. "hide_name": 0,
  162912. "type": "SB_DFFER",
  162913. "parameters": {
  162914. },
  162915. "attributes": {
  162916. "RBEL_GROUP": " ",
  162917. "RBEL_X": "00000000000000000000000000000000",
  162918. "RBEL_Y": "00000000000000000000000000000000",
  162919. "RBEL_Z": "00000000000000000000000000000010",
  162920. "dont_touch": "true",
  162921. "hdlname": "vid_I tgen_I v_cnt_I bit[2].genblk1.dff_I",
  162922. "module_not_derived": "00000000000000000000000000000001",
  162923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  162924. },
  162925. "port_directions": {
  162926. "C": "input",
  162927. "D": "input",
  162928. "E": "input",
  162929. "Q": "output",
  162930. "R": "input"
  162931. },
  162932. "connections": {
  162933. "C": [ 42 ],
  162934. "D": [ 6793 ],
  162935. "E": [ 6655 ],
  162936. "Q": [ 6794 ],
  162937. "R": [ 127 ]
  162938. }
  162939. },
  162940. "vid_I.tgen_I.v_cnt_I.bit[2].genblk1.dff_I_Q_SB_CARRY_I0": {
  162941. "hide_name": 0,
  162942. "type": "SB_CARRY",
  162943. "parameters": {
  162944. },
  162945. "attributes": {
  162946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  162947. },
  162948. "port_directions": {
  162949. "CI": "input",
  162950. "CO": "output",
  162951. "I0": "input",
  162952. "I1": "input"
  162953. },
  162954. "connections": {
  162955. "CI": [ 6792 ],
  162956. "CO": [ 6795 ],
  162957. "I0": [ 6794 ],
  162958. "I1": [ "1" ]
  162959. }
  162960. },
  162961. "vid_I.tgen_I.v_cnt_I.bit[2].genblk1.dff_I_Q_SB_LUT4_I1": {
  162962. "hide_name": 0,
  162963. "type": "SB_LUT4",
  162964. "parameters": {
  162965. "LUT_INIT": "0110100110010110"
  162966. },
  162967. "attributes": {
  162968. "module_not_derived": "00000000000000000000000000000001",
  162969. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  162970. },
  162971. "port_directions": {
  162972. "I0": "input",
  162973. "I1": "input",
  162974. "I2": "input",
  162975. "I3": "input",
  162976. "O": "output"
  162977. },
  162978. "connections": {
  162979. "I0": [ "0" ],
  162980. "I1": [ 6794 ],
  162981. "I2": [ "1" ],
  162982. "I3": [ 6792 ],
  162983. "O": [ 6796 ]
  162984. }
  162985. },
  162986. "vid_I.tgen_I.v_cnt_I.bit[3].genblk1.dff_I": {
  162987. "hide_name": 0,
  162988. "type": "SB_DFFER",
  162989. "parameters": {
  162990. },
  162991. "attributes": {
  162992. "RBEL_GROUP": " ",
  162993. "RBEL_X": "00000000000000000000000000000000",
  162994. "RBEL_Y": "00000000000000000000000000000000",
  162995. "RBEL_Z": "00000000000000000000000000000011",
  162996. "dont_touch": "true",
  162997. "hdlname": "vid_I tgen_I v_cnt_I bit[3].genblk1.dff_I",
  162998. "module_not_derived": "00000000000000000000000000000001",
  162999. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163000. },
  163001. "port_directions": {
  163002. "C": "input",
  163003. "D": "input",
  163004. "E": "input",
  163005. "Q": "output",
  163006. "R": "input"
  163007. },
  163008. "connections": {
  163009. "C": [ 42 ],
  163010. "D": [ 6797 ],
  163011. "E": [ 6655 ],
  163012. "Q": [ 6798 ],
  163013. "R": [ 127 ]
  163014. }
  163015. },
  163016. "vid_I.tgen_I.v_cnt_I.bit[3].genblk1.dff_I_Q_SB_CARRY_I0": {
  163017. "hide_name": 0,
  163018. "type": "SB_CARRY",
  163019. "parameters": {
  163020. },
  163021. "attributes": {
  163022. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  163023. },
  163024. "port_directions": {
  163025. "CI": "input",
  163026. "CO": "output",
  163027. "I0": "input",
  163028. "I1": "input"
  163029. },
  163030. "connections": {
  163031. "CI": [ 6795 ],
  163032. "CO": [ 6799 ],
  163033. "I0": [ 6798 ],
  163034. "I1": [ "1" ]
  163035. }
  163036. },
  163037. "vid_I.tgen_I.v_cnt_I.bit[3].genblk1.dff_I_Q_SB_LUT4_I1": {
  163038. "hide_name": 0,
  163039. "type": "SB_LUT4",
  163040. "parameters": {
  163041. "LUT_INIT": "0110100110010110"
  163042. },
  163043. "attributes": {
  163044. "module_not_derived": "00000000000000000000000000000001",
  163045. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163046. },
  163047. "port_directions": {
  163048. "I0": "input",
  163049. "I1": "input",
  163050. "I2": "input",
  163051. "I3": "input",
  163052. "O": "output"
  163053. },
  163054. "connections": {
  163055. "I0": [ "0" ],
  163056. "I1": [ 6798 ],
  163057. "I2": [ "1" ],
  163058. "I3": [ 6795 ],
  163059. "O": [ 6800 ]
  163060. }
  163061. },
  163062. "vid_I.tgen_I.v_cnt_I.bit[4].genblk1.dff_I": {
  163063. "hide_name": 0,
  163064. "type": "SB_DFFER",
  163065. "parameters": {
  163066. },
  163067. "attributes": {
  163068. "RBEL_GROUP": " ",
  163069. "RBEL_X": "00000000000000000000000000000000",
  163070. "RBEL_Y": "00000000000000000000000000000000",
  163071. "RBEL_Z": "00000000000000000000000000000100",
  163072. "dont_touch": "true",
  163073. "hdlname": "vid_I tgen_I v_cnt_I bit[4].genblk1.dff_I",
  163074. "module_not_derived": "00000000000000000000000000000001",
  163075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163076. },
  163077. "port_directions": {
  163078. "C": "input",
  163079. "D": "input",
  163080. "E": "input",
  163081. "Q": "output",
  163082. "R": "input"
  163083. },
  163084. "connections": {
  163085. "C": [ 42 ],
  163086. "D": [ 6801 ],
  163087. "E": [ 6655 ],
  163088. "Q": [ 6802 ],
  163089. "R": [ 127 ]
  163090. }
  163091. },
  163092. "vid_I.tgen_I.v_cnt_I.bit[4].genblk1.dff_I_Q_SB_CARRY_I0": {
  163093. "hide_name": 0,
  163094. "type": "SB_CARRY",
  163095. "parameters": {
  163096. },
  163097. "attributes": {
  163098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  163099. },
  163100. "port_directions": {
  163101. "CI": "input",
  163102. "CO": "output",
  163103. "I0": "input",
  163104. "I1": "input"
  163105. },
  163106. "connections": {
  163107. "CI": [ 6799 ],
  163108. "CO": [ 6803 ],
  163109. "I0": [ 6802 ],
  163110. "I1": [ "1" ]
  163111. }
  163112. },
  163113. "vid_I.tgen_I.v_cnt_I.bit[4].genblk1.dff_I_Q_SB_LUT4_I1": {
  163114. "hide_name": 0,
  163115. "type": "SB_LUT4",
  163116. "parameters": {
  163117. "LUT_INIT": "0110100110010110"
  163118. },
  163119. "attributes": {
  163120. "module_not_derived": "00000000000000000000000000000001",
  163121. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163122. },
  163123. "port_directions": {
  163124. "I0": "input",
  163125. "I1": "input",
  163126. "I2": "input",
  163127. "I3": "input",
  163128. "O": "output"
  163129. },
  163130. "connections": {
  163131. "I0": [ "0" ],
  163132. "I1": [ 6802 ],
  163133. "I2": [ "1" ],
  163134. "I3": [ 6799 ],
  163135. "O": [ 6804 ]
  163136. }
  163137. },
  163138. "vid_I.tgen_I.v_cnt_I.bit[5].genblk1.dff_I": {
  163139. "hide_name": 0,
  163140. "type": "SB_DFFER",
  163141. "parameters": {
  163142. },
  163143. "attributes": {
  163144. "RBEL_GROUP": " ",
  163145. "RBEL_X": "00000000000000000000000000000000",
  163146. "RBEL_Y": "00000000000000000000000000000000",
  163147. "RBEL_Z": "00000000000000000000000000000101",
  163148. "dont_touch": "true",
  163149. "hdlname": "vid_I tgen_I v_cnt_I bit[5].genblk1.dff_I",
  163150. "module_not_derived": "00000000000000000000000000000001",
  163151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163152. },
  163153. "port_directions": {
  163154. "C": "input",
  163155. "D": "input",
  163156. "E": "input",
  163157. "Q": "output",
  163158. "R": "input"
  163159. },
  163160. "connections": {
  163161. "C": [ 42 ],
  163162. "D": [ 6805 ],
  163163. "E": [ 6655 ],
  163164. "Q": [ 6806 ],
  163165. "R": [ 127 ]
  163166. }
  163167. },
  163168. "vid_I.tgen_I.v_cnt_I.bit[5].genblk1.dff_I_Q_SB_CARRY_I0": {
  163169. "hide_name": 0,
  163170. "type": "SB_CARRY",
  163171. "parameters": {
  163172. },
  163173. "attributes": {
  163174. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  163175. },
  163176. "port_directions": {
  163177. "CI": "input",
  163178. "CO": "output",
  163179. "I0": "input",
  163180. "I1": "input"
  163181. },
  163182. "connections": {
  163183. "CI": [ 6803 ],
  163184. "CO": [ 6807 ],
  163185. "I0": [ 6806 ],
  163186. "I1": [ "1" ]
  163187. }
  163188. },
  163189. "vid_I.tgen_I.v_cnt_I.bit[6].genblk1.dff_I": {
  163190. "hide_name": 0,
  163191. "type": "SB_DFFER",
  163192. "parameters": {
  163193. },
  163194. "attributes": {
  163195. "RBEL_GROUP": " ",
  163196. "RBEL_X": "00000000000000000000000000000000",
  163197. "RBEL_Y": "00000000000000000000000000000000",
  163198. "RBEL_Z": "00000000000000000000000000000110",
  163199. "dont_touch": "true",
  163200. "hdlname": "vid_I tgen_I v_cnt_I bit[6].genblk1.dff_I",
  163201. "module_not_derived": "00000000000000000000000000000001",
  163202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163203. },
  163204. "port_directions": {
  163205. "C": "input",
  163206. "D": "input",
  163207. "E": "input",
  163208. "Q": "output",
  163209. "R": "input"
  163210. },
  163211. "connections": {
  163212. "C": [ 42 ],
  163213. "D": [ 6808 ],
  163214. "E": [ 6655 ],
  163215. "Q": [ 6809 ],
  163216. "R": [ 127 ]
  163217. }
  163218. },
  163219. "vid_I.tgen_I.v_cnt_I.bit[6].genblk1.dff_I_Q_SB_CARRY_I0": {
  163220. "hide_name": 0,
  163221. "type": "SB_CARRY",
  163222. "parameters": {
  163223. },
  163224. "attributes": {
  163225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  163226. },
  163227. "port_directions": {
  163228. "CI": "input",
  163229. "CO": "output",
  163230. "I0": "input",
  163231. "I1": "input"
  163232. },
  163233. "connections": {
  163234. "CI": [ 6807 ],
  163235. "CO": [ 6810 ],
  163236. "I0": [ 6809 ],
  163237. "I1": [ "1" ]
  163238. }
  163239. },
  163240. "vid_I.tgen_I.v_cnt_I.bit[6].genblk1.dff_I_Q_SB_LUT4_I1": {
  163241. "hide_name": 0,
  163242. "type": "SB_LUT4",
  163243. "parameters": {
  163244. "LUT_INIT": "0110100110010110"
  163245. },
  163246. "attributes": {
  163247. "module_not_derived": "00000000000000000000000000000001",
  163248. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163249. },
  163250. "port_directions": {
  163251. "I0": "input",
  163252. "I1": "input",
  163253. "I2": "input",
  163254. "I3": "input",
  163255. "O": "output"
  163256. },
  163257. "connections": {
  163258. "I0": [ "0" ],
  163259. "I1": [ 6809 ],
  163260. "I2": [ "1" ],
  163261. "I3": [ 6807 ],
  163262. "O": [ 6811 ]
  163263. }
  163264. },
  163265. "vid_I.tgen_I.v_cnt_I.bit[7].genblk1.dff_I": {
  163266. "hide_name": 0,
  163267. "type": "SB_DFFER",
  163268. "parameters": {
  163269. },
  163270. "attributes": {
  163271. "RBEL_GROUP": " ",
  163272. "RBEL_X": "00000000000000000000000000000000",
  163273. "RBEL_Y": "00000000000000000000000000000000",
  163274. "RBEL_Z": "00000000000000000000000000000111",
  163275. "dont_touch": "true",
  163276. "hdlname": "vid_I tgen_I v_cnt_I bit[7].genblk1.dff_I",
  163277. "module_not_derived": "00000000000000000000000000000001",
  163278. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163279. },
  163280. "port_directions": {
  163281. "C": "input",
  163282. "D": "input",
  163283. "E": "input",
  163284. "Q": "output",
  163285. "R": "input"
  163286. },
  163287. "connections": {
  163288. "C": [ 42 ],
  163289. "D": [ 6812 ],
  163290. "E": [ 6655 ],
  163291. "Q": [ 6813 ],
  163292. "R": [ 127 ]
  163293. }
  163294. },
  163295. "vid_I.tgen_I.v_cnt_I.bit[7].genblk1.dff_I_Q_SB_CARRY_I0": {
  163296. "hide_name": 0,
  163297. "type": "SB_CARRY",
  163298. "parameters": {
  163299. },
  163300. "attributes": {
  163301. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  163302. },
  163303. "port_directions": {
  163304. "CI": "input",
  163305. "CO": "output",
  163306. "I0": "input",
  163307. "I1": "input"
  163308. },
  163309. "connections": {
  163310. "CI": [ 6810 ],
  163311. "CO": [ 6814 ],
  163312. "I0": [ 6813 ],
  163313. "I1": [ "1" ]
  163314. }
  163315. },
  163316. "vid_I.tgen_I.v_cnt_I.bit[7].genblk1.dff_I_Q_SB_LUT4_I1": {
  163317. "hide_name": 0,
  163318. "type": "SB_LUT4",
  163319. "parameters": {
  163320. "LUT_INIT": "0110100110010110"
  163321. },
  163322. "attributes": {
  163323. "module_not_derived": "00000000000000000000000000000001",
  163324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163325. },
  163326. "port_directions": {
  163327. "I0": "input",
  163328. "I1": "input",
  163329. "I2": "input",
  163330. "I3": "input",
  163331. "O": "output"
  163332. },
  163333. "connections": {
  163334. "I0": [ "0" ],
  163335. "I1": [ 6813 ],
  163336. "I2": [ "1" ],
  163337. "I3": [ 6810 ],
  163338. "O": [ 6815 ]
  163339. }
  163340. },
  163341. "vid_I.tgen_I.v_cnt_I.bit[8].genblk1.dff_I": {
  163342. "hide_name": 0,
  163343. "type": "SB_DFFER",
  163344. "parameters": {
  163345. },
  163346. "attributes": {
  163347. "RBEL_GROUP": " ",
  163348. "RBEL_X": "00000000000000000000000000000000",
  163349. "RBEL_Y": "00000000000000000000000000000001",
  163350. "RBEL_Z": "00000000000000000000000000000000",
  163351. "dont_touch": "true",
  163352. "hdlname": "vid_I tgen_I v_cnt_I bit[8].genblk1.dff_I",
  163353. "module_not_derived": "00000000000000000000000000000001",
  163354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163355. },
  163356. "port_directions": {
  163357. "C": "input",
  163358. "D": "input",
  163359. "E": "input",
  163360. "Q": "output",
  163361. "R": "input"
  163362. },
  163363. "connections": {
  163364. "C": [ 42 ],
  163365. "D": [ 6816 ],
  163366. "E": [ 6655 ],
  163367. "Q": [ 6817 ],
  163368. "R": [ 127 ]
  163369. }
  163370. },
  163371. "vid_I.tgen_I.v_cnt_I.bit[8].genblk1.dff_I_Q_SB_CARRY_I0": {
  163372. "hide_name": 0,
  163373. "type": "SB_CARRY",
  163374. "parameters": {
  163375. },
  163376. "attributes": {
  163377. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  163378. },
  163379. "port_directions": {
  163380. "CI": "input",
  163381. "CO": "output",
  163382. "I0": "input",
  163383. "I1": "input"
  163384. },
  163385. "connections": {
  163386. "CI": [ 6814 ],
  163387. "CO": [ 6818 ],
  163388. "I0": [ 6817 ],
  163389. "I1": [ "1" ]
  163390. }
  163391. },
  163392. "vid_I.tgen_I.v_cnt_I.bit[8].genblk1.dff_I_Q_SB_LUT4_I1": {
  163393. "hide_name": 0,
  163394. "type": "SB_LUT4",
  163395. "parameters": {
  163396. "LUT_INIT": "0110100110010110"
  163397. },
  163398. "attributes": {
  163399. "module_not_derived": "00000000000000000000000000000001",
  163400. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163401. },
  163402. "port_directions": {
  163403. "I0": "input",
  163404. "I1": "input",
  163405. "I2": "input",
  163406. "I3": "input",
  163407. "O": "output"
  163408. },
  163409. "connections": {
  163410. "I0": [ "0" ],
  163411. "I1": [ 6817 ],
  163412. "I2": [ "1" ],
  163413. "I3": [ 6814 ],
  163414. "O": [ 6819 ]
  163415. }
  163416. },
  163417. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I": {
  163418. "hide_name": 0,
  163419. "type": "SB_DFFER",
  163420. "parameters": {
  163421. },
  163422. "attributes": {
  163423. "RBEL_GROUP": " ",
  163424. "RBEL_X": "00000000000000000000000000000000",
  163425. "RBEL_Y": "00000000000000000000000000000001",
  163426. "RBEL_Z": "00000000000000000000000000000001",
  163427. "dont_touch": "true",
  163428. "hdlname": "vid_I tgen_I v_cnt_I bit[9].genblk1.dff_I",
  163429. "module_not_derived": "00000000000000000000000000000001",
  163430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:206.14-212.6"
  163431. },
  163432. "port_directions": {
  163433. "C": "input",
  163434. "D": "input",
  163435. "E": "input",
  163436. "Q": "output",
  163437. "R": "input"
  163438. },
  163439. "connections": {
  163440. "C": [ 42 ],
  163441. "D": [ 6820 ],
  163442. "E": [ 6655 ],
  163443. "Q": [ 6654 ],
  163444. "R": [ 127 ]
  163445. }
  163446. },
  163447. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_DFFR_Q": {
  163448. "hide_name": 0,
  163449. "type": "SB_DFFR",
  163450. "parameters": {
  163451. },
  163452. "attributes": {
  163453. "module_not_derived": "00000000000000000000000000000001",
  163454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:141.2-145.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  163455. },
  163456. "port_directions": {
  163457. "C": "input",
  163458. "D": "input",
  163459. "Q": "output",
  163460. "R": "input"
  163461. },
  163462. "connections": {
  163463. "C": [ 42 ],
  163464. "D": [ 6821 ],
  163465. "Q": [ 6650 ],
  163466. "R": [ 127 ]
  163467. }
  163468. },
  163469. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_DFFR_Q_1": {
  163470. "hide_name": 0,
  163471. "type": "SB_DFFR",
  163472. "parameters": {
  163473. },
  163474. "attributes": {
  163475. "module_not_derived": "00000000000000000000000000000001",
  163476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:141.2-145.30|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  163477. },
  163478. "port_directions": {
  163479. "C": "input",
  163480. "D": "input",
  163481. "Q": "output",
  163482. "R": "input"
  163483. },
  163484. "connections": {
  163485. "C": [ 42 ],
  163486. "D": [ 6822 ],
  163487. "Q": [ 6651 ],
  163488. "R": [ 127 ]
  163489. }
  163490. },
  163491. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_DFFR_Q_1_D_SB_LUT4_O": {
  163492. "hide_name": 0,
  163493. "type": "SB_LUT4",
  163494. "parameters": {
  163495. "LUT_INIT": "0011110011001100"
  163496. },
  163497. "attributes": {
  163498. "module_not_derived": "00000000000000000000000000000001",
  163499. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  163500. },
  163501. "port_directions": {
  163502. "I0": "input",
  163503. "I1": "input",
  163504. "I2": "input",
  163505. "I3": "input",
  163506. "O": "output"
  163507. },
  163508. "connections": {
  163509. "I0": [ "0" ],
  163510. "I1": [ 6651 ],
  163511. "I2": [ 6654 ],
  163512. "I3": [ 6655 ],
  163513. "O": [ 6822 ]
  163514. }
  163515. },
  163516. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_DFFR_Q_D_SB_LUT4_O": {
  163517. "hide_name": 0,
  163518. "type": "SB_LUT4",
  163519. "parameters": {
  163520. "LUT_INIT": "0110101010101010"
  163521. },
  163522. "attributes": {
  163523. "module_not_derived": "00000000000000000000000000000001",
  163524. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163525. },
  163526. "port_directions": {
  163527. "I0": "input",
  163528. "I1": "input",
  163529. "I2": "input",
  163530. "I3": "input",
  163531. "O": "output"
  163532. },
  163533. "connections": {
  163534. "I0": [ 6650 ],
  163535. "I1": [ 6651 ],
  163536. "I2": [ 6654 ],
  163537. "I3": [ 6655 ],
  163538. "O": [ 6821 ]
  163539. }
  163540. },
  163541. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_LUT4_O": {
  163542. "hide_name": 0,
  163543. "type": "SB_LUT4",
  163544. "parameters": {
  163545. "LUT_INIT": "0110100110010110"
  163546. },
  163547. "attributes": {
  163548. "module_not_derived": "00000000000000000000000000000001",
  163549. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163550. },
  163551. "port_directions": {
  163552. "I0": "input",
  163553. "I1": "input",
  163554. "I2": "input",
  163555. "I3": "input",
  163556. "O": "output"
  163557. },
  163558. "connections": {
  163559. "I0": [ "0" ],
  163560. "I1": [ 6791 ],
  163561. "I2": [ "1" ],
  163562. "I3": [ 6789 ],
  163563. "O": [ 6823 ]
  163564. }
  163565. },
  163566. "vid_I.tgen_I.v_cnt_I.ce_SB_LUT4_O": {
  163567. "hide_name": 0,
  163568. "type": "SB_LUT4",
  163569. "parameters": {
  163570. "LUT_INIT": "1100000000000000"
  163571. },
  163572. "attributes": {
  163573. "module_not_derived": "00000000000000000000000000000001",
  163574. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  163575. },
  163576. "port_directions": {
  163577. "I0": "input",
  163578. "I1": "input",
  163579. "I2": "input",
  163580. "I3": "input",
  163581. "O": "output"
  163582. },
  163583. "connections": {
  163584. "I0": [ "0" ],
  163585. "I1": [ 6518 ],
  163586. "I2": [ 6519 ],
  163587. "I3": [ 6752 ],
  163588. "O": [ 6655 ]
  163589. }
  163590. },
  163591. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O": {
  163592. "hide_name": 0,
  163593. "type": "SB_LUT4",
  163594. "parameters": {
  163595. "LUT_INIT": "0010000100010010"
  163596. },
  163597. "attributes": {
  163598. "module_not_derived": "00000000000000000000000000000001",
  163599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163600. },
  163601. "port_directions": {
  163602. "I0": "input",
  163603. "I1": "input",
  163604. "I2": "input",
  163605. "I3": "input",
  163606. "O": "output"
  163607. },
  163608. "connections": {
  163609. "I0": [ "0" ],
  163610. "I1": [ 6654 ],
  163611. "I2": [ "1" ],
  163612. "I3": [ 6818 ],
  163613. "O": [ 6820 ]
  163614. }
  163615. },
  163616. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_1": {
  163617. "hide_name": 0,
  163618. "type": "SB_LUT4",
  163619. "parameters": {
  163620. "LUT_INIT": "0100000100010100"
  163621. },
  163622. "attributes": {
  163623. "module_not_derived": "00000000000000000000000000000001",
  163624. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163625. },
  163626. "port_directions": {
  163627. "I0": "input",
  163628. "I1": "input",
  163629. "I2": "input",
  163630. "I3": "input",
  163631. "O": "output"
  163632. },
  163633. "connections": {
  163634. "I0": [ 6654 ],
  163635. "I1": [ 6806 ],
  163636. "I2": [ "1" ],
  163637. "I3": [ 6803 ],
  163638. "O": [ 6805 ]
  163639. }
  163640. },
  163641. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_2": {
  163642. "hide_name": 0,
  163643. "type": "SB_LUT4",
  163644. "parameters": {
  163645. "LUT_INIT": "0110111101100000"
  163646. },
  163647. "attributes": {
  163648. "module_not_derived": "00000000000000000000000000000001",
  163649. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163650. },
  163651. "port_directions": {
  163652. "I0": "input",
  163653. "I1": "input",
  163654. "I2": "input",
  163655. "I3": "input",
  163656. "O": "output"
  163657. },
  163658. "connections": {
  163659. "I0": [ 6650 ],
  163660. "I1": [ 6651 ],
  163661. "I2": [ 6654 ],
  163662. "I3": [ 6823 ],
  163663. "O": [ 6790 ]
  163664. }
  163665. },
  163666. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_3": {
  163667. "hide_name": 0,
  163668. "type": "SB_LUT4",
  163669. "parameters": {
  163670. "LUT_INIT": "0110111101100000"
  163671. },
  163672. "attributes": {
  163673. "module_not_derived": "00000000000000000000000000000001",
  163674. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163675. },
  163676. "port_directions": {
  163677. "I0": "input",
  163678. "I1": "input",
  163679. "I2": "input",
  163680. "I3": "input",
  163681. "O": "output"
  163682. },
  163683. "connections": {
  163684. "I0": [ 6650 ],
  163685. "I1": [ 6651 ],
  163686. "I2": [ 6654 ],
  163687. "I3": [ 6796 ],
  163688. "O": [ 6793 ]
  163689. }
  163690. },
  163691. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_4": {
  163692. "hide_name": 0,
  163693. "type": "SB_LUT4",
  163694. "parameters": {
  163695. "LUT_INIT": "0110111101100000"
  163696. },
  163697. "attributes": {
  163698. "module_not_derived": "00000000000000000000000000000001",
  163699. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163700. },
  163701. "port_directions": {
  163702. "I0": "input",
  163703. "I1": "input",
  163704. "I2": "input",
  163705. "I3": "input",
  163706. "O": "output"
  163707. },
  163708. "connections": {
  163709. "I0": [ 6650 ],
  163710. "I1": [ 6651 ],
  163711. "I2": [ 6654 ],
  163712. "I3": [ 6804 ],
  163713. "O": [ 6801 ]
  163714. }
  163715. },
  163716. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_5": {
  163717. "hide_name": 0,
  163718. "type": "SB_LUT4",
  163719. "parameters": {
  163720. "LUT_INIT": "0010111100100000"
  163721. },
  163722. "attributes": {
  163723. "module_not_derived": "00000000000000000000000000000001",
  163724. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163725. },
  163726. "port_directions": {
  163727. "I0": "input",
  163728. "I1": "input",
  163729. "I2": "input",
  163730. "I3": "input",
  163731. "O": "output"
  163732. },
  163733. "connections": {
  163734. "I0": [ 6650 ],
  163735. "I1": [ 6651 ],
  163736. "I2": [ 6654 ],
  163737. "I3": [ 6811 ],
  163738. "O": [ 6808 ]
  163739. }
  163740. },
  163741. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_6": {
  163742. "hide_name": 0,
  163743. "type": "SB_LUT4",
  163744. "parameters": {
  163745. "LUT_INIT": "0010111100100000"
  163746. },
  163747. "attributes": {
  163748. "module_not_derived": "00000000000000000000000000000001",
  163749. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163750. },
  163751. "port_directions": {
  163752. "I0": "input",
  163753. "I1": "input",
  163754. "I2": "input",
  163755. "I3": "input",
  163756. "O": "output"
  163757. },
  163758. "connections": {
  163759. "I0": [ 6650 ],
  163760. "I1": [ 6651 ],
  163761. "I2": [ 6654 ],
  163762. "I3": [ 6815 ],
  163763. "O": [ 6812 ]
  163764. }
  163765. },
  163766. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_7": {
  163767. "hide_name": 0,
  163768. "type": "SB_LUT4",
  163769. "parameters": {
  163770. "LUT_INIT": "0010111100100000"
  163771. },
  163772. "attributes": {
  163773. "module_not_derived": "00000000000000000000000000000001",
  163774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163775. },
  163776. "port_directions": {
  163777. "I0": "input",
  163778. "I1": "input",
  163779. "I2": "input",
  163780. "I3": "input",
  163781. "O": "output"
  163782. },
  163783. "connections": {
  163784. "I0": [ 6650 ],
  163785. "I1": [ 6651 ],
  163786. "I2": [ 6654 ],
  163787. "I3": [ 6819 ],
  163788. "O": [ 6816 ]
  163789. }
  163790. },
  163791. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_8": {
  163792. "hide_name": 0,
  163793. "type": "SB_LUT4",
  163794. "parameters": {
  163795. "LUT_INIT": "1100111100000011"
  163796. },
  163797. "attributes": {
  163798. "module_not_derived": "00000000000000000000000000000001",
  163799. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  163800. },
  163801. "port_directions": {
  163802. "I0": "input",
  163803. "I1": "input",
  163804. "I2": "input",
  163805. "I3": "input",
  163806. "O": "output"
  163807. },
  163808. "connections": {
  163809. "I0": [ "0" ],
  163810. "I1": [ 6654 ],
  163811. "I2": [ 6789 ],
  163812. "I3": [ 6526 ],
  163813. "O": [ 6788 ]
  163814. }
  163815. },
  163816. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_8_I3_SB_LUT4_O": {
  163817. "hide_name": 0,
  163818. "type": "SB_LUT4",
  163819. "parameters": {
  163820. "LUT_INIT": "0000111100000000"
  163821. },
  163822. "attributes": {
  163823. "module_not_derived": "00000000000000000000000000000001",
  163824. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  163825. },
  163826. "port_directions": {
  163827. "I0": "input",
  163828. "I1": "input",
  163829. "I2": "input",
  163830. "I3": "input",
  163831. "O": "output"
  163832. },
  163833. "connections": {
  163834. "I0": [ "0" ],
  163835. "I1": [ "0" ],
  163836. "I2": [ 6650 ],
  163837. "I3": [ 6651 ],
  163838. "O": [ 6526 ]
  163839. }
  163840. },
  163841. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_9": {
  163842. "hide_name": 0,
  163843. "type": "SB_LUT4",
  163844. "parameters": {
  163845. "LUT_INIT": "1110111111100000"
  163846. },
  163847. "attributes": {
  163848. "module_not_derived": "00000000000000000000000000000001",
  163849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163850. },
  163851. "port_directions": {
  163852. "I0": "input",
  163853. "I1": "input",
  163854. "I2": "input",
  163855. "I3": "input",
  163856. "O": "output"
  163857. },
  163858. "connections": {
  163859. "I0": [ 6650 ],
  163860. "I1": [ 6651 ],
  163861. "I2": [ 6654 ],
  163862. "I3": [ 6800 ],
  163863. "O": [ 6797 ]
  163864. }
  163865. },
  163866. "vid_I.tgen_I.vid_active_SB_DFFR_Q": {
  163867. "hide_name": 0,
  163868. "type": "SB_DFFR",
  163869. "parameters": {
  163870. },
  163871. "attributes": {
  163872. "module_not_derived": "00000000000000000000000000000001",
  163873. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  163874. },
  163875. "port_directions": {
  163876. "C": "input",
  163877. "D": "input",
  163878. "Q": "output",
  163879. "R": "input"
  163880. },
  163881. "connections": {
  163882. "C": [ 42 ],
  163883. "D": [ 6824 ],
  163884. "Q": [ 6609 ],
  163885. "R": [ 127 ]
  163886. }
  163887. },
  163888. "vid_I.tgen_I.vid_active_SB_DFFR_Q_D_SB_LUT4_O": {
  163889. "hide_name": 0,
  163890. "type": "SB_LUT4",
  163891. "parameters": {
  163892. "LUT_INIT": "1000000000000000"
  163893. },
  163894. "attributes": {
  163895. "module_not_derived": "00000000000000000000000000000001",
  163896. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  163897. },
  163898. "port_directions": {
  163899. "I0": "input",
  163900. "I1": "input",
  163901. "I2": "input",
  163902. "I3": "input",
  163903. "O": "output"
  163904. },
  163905. "connections": {
  163906. "I0": [ 6650 ],
  163907. "I1": [ 6651 ],
  163908. "I2": [ 6518 ],
  163909. "I3": [ 6519 ],
  163910. "O": [ 6824 ]
  163911. }
  163912. },
  163913. "vid_I.tgen_I.vid_h_first_SB_DFFR_Q": {
  163914. "hide_name": 0,
  163915. "type": "SB_DFFR",
  163916. "parameters": {
  163917. },
  163918. "attributes": {
  163919. "module_not_derived": "00000000000000000000000000000001",
  163920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  163921. },
  163922. "port_directions": {
  163923. "C": "input",
  163924. "D": "input",
  163925. "Q": "output",
  163926. "R": "input"
  163927. },
  163928. "connections": {
  163929. "C": [ 42 ],
  163930. "D": [ 6825 ],
  163931. "Q": [ 6611 ],
  163932. "R": [ 127 ]
  163933. }
  163934. },
  163935. "vid_I.tgen_I.vid_h_first_SB_DFFR_Q_D_SB_LUT4_O": {
  163936. "hide_name": 0,
  163937. "type": "SB_LUT4",
  163938. "parameters": {
  163939. "LUT_INIT": "1100000000000000"
  163940. },
  163941. "attributes": {
  163942. "module_not_derived": "00000000000000000000000000000001",
  163943. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  163944. },
  163945. "port_directions": {
  163946. "I0": "input",
  163947. "I1": "input",
  163948. "I2": "input",
  163949. "I3": "input",
  163950. "O": "output"
  163951. },
  163952. "connections": {
  163953. "I0": [ "0" ],
  163954. "I1": [ 6826 ],
  163955. "I2": [ 6518 ],
  163956. "I3": [ 6519 ],
  163957. "O": [ 6825 ]
  163958. }
  163959. },
  163960. "vid_I.tgen_I.vid_h_first_SB_DFFR_Q_D_SB_LUT4_O_I1_SB_DFFS_Q": {
  163961. "hide_name": 0,
  163962. "type": "SB_DFFS",
  163963. "parameters": {
  163964. },
  163965. "attributes": {
  163966. "module_not_derived": "00000000000000000000000000000001",
  163967. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:96.2-100.22|/usr/bin/../share/yosys/ice40/ff_map.v:10.57-10.103"
  163968. },
  163969. "port_directions": {
  163970. "C": "input",
  163971. "D": "input",
  163972. "Q": "output",
  163973. "S": "input"
  163974. },
  163975. "connections": {
  163976. "C": [ 42 ],
  163977. "D": [ 6752 ],
  163978. "Q": [ 6826 ],
  163979. "S": [ 127 ]
  163980. }
  163981. },
  163982. "vid_I.vs_frame_cnt_SB_DFFSR_Q": {
  163983. "hide_name": 0,
  163984. "type": "SB_DFFSR",
  163985. "parameters": {
  163986. },
  163987. "attributes": {
  163988. "module_not_derived": "00000000000000000000000000000001",
  163989. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  163990. },
  163991. "port_directions": {
  163992. "C": "input",
  163993. "D": "input",
  163994. "Q": "output",
  163995. "R": "input"
  163996. },
  163997. "connections": {
  163998. "C": [ 42 ],
  163999. "D": [ 6827 ],
  164000. "Q": [ 6828 ],
  164001. "R": [ 127 ]
  164002. }
  164003. },
  164004. "vid_I.vs_frame_cnt_SB_DFFSR_Q_1": {
  164005. "hide_name": 0,
  164006. "type": "SB_DFFSR",
  164007. "parameters": {
  164008. },
  164009. "attributes": {
  164010. "module_not_derived": "00000000000000000000000000000001",
  164011. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164012. },
  164013. "port_directions": {
  164014. "C": "input",
  164015. "D": "input",
  164016. "Q": "output",
  164017. "R": "input"
  164018. },
  164019. "connections": {
  164020. "C": [ 42 ],
  164021. "D": [ 6829 ],
  164022. "Q": [ 6830 ],
  164023. "R": [ 127 ]
  164024. }
  164025. },
  164026. "vid_I.vs_frame_cnt_SB_DFFSR_Q_10": {
  164027. "hide_name": 0,
  164028. "type": "SB_DFFSR",
  164029. "parameters": {
  164030. },
  164031. "attributes": {
  164032. "module_not_derived": "00000000000000000000000000000001",
  164033. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164034. },
  164035. "port_directions": {
  164036. "C": "input",
  164037. "D": "input",
  164038. "Q": "output",
  164039. "R": "input"
  164040. },
  164041. "connections": {
  164042. "C": [ 42 ],
  164043. "D": [ 6831 ],
  164044. "Q": [ 6832 ],
  164045. "R": [ 127 ]
  164046. }
  164047. },
  164048. "vid_I.vs_frame_cnt_SB_DFFSR_Q_11": {
  164049. "hide_name": 0,
  164050. "type": "SB_DFFSR",
  164051. "parameters": {
  164052. },
  164053. "attributes": {
  164054. "module_not_derived": "00000000000000000000000000000001",
  164055. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164056. },
  164057. "port_directions": {
  164058. "C": "input",
  164059. "D": "input",
  164060. "Q": "output",
  164061. "R": "input"
  164062. },
  164063. "connections": {
  164064. "C": [ 42 ],
  164065. "D": [ 6833 ],
  164066. "Q": [ 6834 ],
  164067. "R": [ 127 ]
  164068. }
  164069. },
  164070. "vid_I.vs_frame_cnt_SB_DFFSR_Q_12": {
  164071. "hide_name": 0,
  164072. "type": "SB_DFFSR",
  164073. "parameters": {
  164074. },
  164075. "attributes": {
  164076. "module_not_derived": "00000000000000000000000000000001",
  164077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164078. },
  164079. "port_directions": {
  164080. "C": "input",
  164081. "D": "input",
  164082. "Q": "output",
  164083. "R": "input"
  164084. },
  164085. "connections": {
  164086. "C": [ 42 ],
  164087. "D": [ 6835 ],
  164088. "Q": [ 6836 ],
  164089. "R": [ 127 ]
  164090. }
  164091. },
  164092. "vid_I.vs_frame_cnt_SB_DFFSR_Q_13": {
  164093. "hide_name": 0,
  164094. "type": "SB_DFFSR",
  164095. "parameters": {
  164096. },
  164097. "attributes": {
  164098. "module_not_derived": "00000000000000000000000000000001",
  164099. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164100. },
  164101. "port_directions": {
  164102. "C": "input",
  164103. "D": "input",
  164104. "Q": "output",
  164105. "R": "input"
  164106. },
  164107. "connections": {
  164108. "C": [ 42 ],
  164109. "D": [ 6837 ],
  164110. "Q": [ 6838 ],
  164111. "R": [ 127 ]
  164112. }
  164113. },
  164114. "vid_I.vs_frame_cnt_SB_DFFSR_Q_14": {
  164115. "hide_name": 0,
  164116. "type": "SB_DFFSR",
  164117. "parameters": {
  164118. },
  164119. "attributes": {
  164120. "module_not_derived": "00000000000000000000000000000001",
  164121. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164122. },
  164123. "port_directions": {
  164124. "C": "input",
  164125. "D": "input",
  164126. "Q": "output",
  164127. "R": "input"
  164128. },
  164129. "connections": {
  164130. "C": [ 42 ],
  164131. "D": [ 6839 ],
  164132. "Q": [ 6840 ],
  164133. "R": [ 127 ]
  164134. }
  164135. },
  164136. "vid_I.vs_frame_cnt_SB_DFFSR_Q_15": {
  164137. "hide_name": 0,
  164138. "type": "SB_DFFSR",
  164139. "parameters": {
  164140. },
  164141. "attributes": {
  164142. "module_not_derived": "00000000000000000000000000000001",
  164143. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164144. },
  164145. "port_directions": {
  164146. "C": "input",
  164147. "D": "input",
  164148. "Q": "output",
  164149. "R": "input"
  164150. },
  164151. "connections": {
  164152. "C": [ 42 ],
  164153. "D": [ 6841 ],
  164154. "Q": [ 6842 ],
  164155. "R": [ 127 ]
  164156. }
  164157. },
  164158. "vid_I.vs_frame_cnt_SB_DFFSR_Q_2": {
  164159. "hide_name": 0,
  164160. "type": "SB_DFFSR",
  164161. "parameters": {
  164162. },
  164163. "attributes": {
  164164. "module_not_derived": "00000000000000000000000000000001",
  164165. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164166. },
  164167. "port_directions": {
  164168. "C": "input",
  164169. "D": "input",
  164170. "Q": "output",
  164171. "R": "input"
  164172. },
  164173. "connections": {
  164174. "C": [ 42 ],
  164175. "D": [ 6843 ],
  164176. "Q": [ 6844 ],
  164177. "R": [ 127 ]
  164178. }
  164179. },
  164180. "vid_I.vs_frame_cnt_SB_DFFSR_Q_3": {
  164181. "hide_name": 0,
  164182. "type": "SB_DFFSR",
  164183. "parameters": {
  164184. },
  164185. "attributes": {
  164186. "module_not_derived": "00000000000000000000000000000001",
  164187. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164188. },
  164189. "port_directions": {
  164190. "C": "input",
  164191. "D": "input",
  164192. "Q": "output",
  164193. "R": "input"
  164194. },
  164195. "connections": {
  164196. "C": [ 42 ],
  164197. "D": [ 6845 ],
  164198. "Q": [ 6846 ],
  164199. "R": [ 127 ]
  164200. }
  164201. },
  164202. "vid_I.vs_frame_cnt_SB_DFFSR_Q_4": {
  164203. "hide_name": 0,
  164204. "type": "SB_DFFSR",
  164205. "parameters": {
  164206. },
  164207. "attributes": {
  164208. "module_not_derived": "00000000000000000000000000000001",
  164209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164210. },
  164211. "port_directions": {
  164212. "C": "input",
  164213. "D": "input",
  164214. "Q": "output",
  164215. "R": "input"
  164216. },
  164217. "connections": {
  164218. "C": [ 42 ],
  164219. "D": [ 6847 ],
  164220. "Q": [ 6848 ],
  164221. "R": [ 127 ]
  164222. }
  164223. },
  164224. "vid_I.vs_frame_cnt_SB_DFFSR_Q_5": {
  164225. "hide_name": 0,
  164226. "type": "SB_DFFSR",
  164227. "parameters": {
  164228. },
  164229. "attributes": {
  164230. "module_not_derived": "00000000000000000000000000000001",
  164231. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164232. },
  164233. "port_directions": {
  164234. "C": "input",
  164235. "D": "input",
  164236. "Q": "output",
  164237. "R": "input"
  164238. },
  164239. "connections": {
  164240. "C": [ 42 ],
  164241. "D": [ 6849 ],
  164242. "Q": [ 6850 ],
  164243. "R": [ 127 ]
  164244. }
  164245. },
  164246. "vid_I.vs_frame_cnt_SB_DFFSR_Q_6": {
  164247. "hide_name": 0,
  164248. "type": "SB_DFFSR",
  164249. "parameters": {
  164250. },
  164251. "attributes": {
  164252. "module_not_derived": "00000000000000000000000000000001",
  164253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164254. },
  164255. "port_directions": {
  164256. "C": "input",
  164257. "D": "input",
  164258. "Q": "output",
  164259. "R": "input"
  164260. },
  164261. "connections": {
  164262. "C": [ 42 ],
  164263. "D": [ 6851 ],
  164264. "Q": [ 6852 ],
  164265. "R": [ 127 ]
  164266. }
  164267. },
  164268. "vid_I.vs_frame_cnt_SB_DFFSR_Q_7": {
  164269. "hide_name": 0,
  164270. "type": "SB_DFFSR",
  164271. "parameters": {
  164272. },
  164273. "attributes": {
  164274. "module_not_derived": "00000000000000000000000000000001",
  164275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164276. },
  164277. "port_directions": {
  164278. "C": "input",
  164279. "D": "input",
  164280. "Q": "output",
  164281. "R": "input"
  164282. },
  164283. "connections": {
  164284. "C": [ 42 ],
  164285. "D": [ 6853 ],
  164286. "Q": [ 6854 ],
  164287. "R": [ 127 ]
  164288. }
  164289. },
  164290. "vid_I.vs_frame_cnt_SB_DFFSR_Q_8": {
  164291. "hide_name": 0,
  164292. "type": "SB_DFFSR",
  164293. "parameters": {
  164294. },
  164295. "attributes": {
  164296. "module_not_derived": "00000000000000000000000000000001",
  164297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164298. },
  164299. "port_directions": {
  164300. "C": "input",
  164301. "D": "input",
  164302. "Q": "output",
  164303. "R": "input"
  164304. },
  164305. "connections": {
  164306. "C": [ 42 ],
  164307. "D": [ 6855 ],
  164308. "Q": [ 6856 ],
  164309. "R": [ 127 ]
  164310. }
  164311. },
  164312. "vid_I.vs_frame_cnt_SB_DFFSR_Q_9": {
  164313. "hide_name": 0,
  164314. "type": "SB_DFFSR",
  164315. "parameters": {
  164316. },
  164317. "attributes": {
  164318. "module_not_derived": "00000000000000000000000000000001",
  164319. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:178.2-182.63|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  164320. },
  164321. "port_directions": {
  164322. "C": "input",
  164323. "D": "input",
  164324. "Q": "output",
  164325. "R": "input"
  164326. },
  164327. "connections": {
  164328. "C": [ 42 ],
  164329. "D": [ 6857 ],
  164330. "Q": [ 6858 ],
  164331. "R": [ 127 ]
  164332. }
  164333. },
  164334. "vid_I.vs_in_vbl_SB_DFF_Q": {
  164335. "hide_name": 0,
  164336. "type": "SB_DFF",
  164337. "parameters": {
  164338. },
  164339. "attributes": {
  164340. "module_not_derived": "00000000000000000000000000000001",
  164341. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:175.2-176.74|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  164342. },
  164343. "port_directions": {
  164344. "C": "input",
  164345. "D": "input",
  164346. "Q": "output"
  164347. },
  164348. "connections": {
  164349. "C": [ 42 ],
  164350. "D": [ 6859 ],
  164351. "Q": [ 6860 ]
  164352. }
  164353. },
  164354. "vid_I.vs_in_vbl_SB_LUT4_I1": {
  164355. "hide_name": 0,
  164356. "type": "SB_LUT4",
  164357. "parameters": {
  164358. "LUT_INIT": "1111111100001100"
  164359. },
  164360. "attributes": {
  164361. "module_not_derived": "00000000000000000000000000000001",
  164362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  164363. },
  164364. "port_directions": {
  164365. "I0": "input",
  164366. "I1": "input",
  164367. "I2": "input",
  164368. "I3": "input",
  164369. "O": "output"
  164370. },
  164371. "connections": {
  164372. "I0": [ "0" ],
  164373. "I1": [ 6860 ],
  164374. "I2": [ 6613 ],
  164375. "I3": [ 6861 ],
  164376. "O": [ 6859 ]
  164377. }
  164378. },
  164379. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_CARRY_I1": {
  164380. "hide_name": 0,
  164381. "type": "SB_CARRY",
  164382. "parameters": {
  164383. },
  164384. "attributes": {
  164385. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164386. },
  164387. "port_directions": {
  164388. "CI": "input",
  164389. "CO": "output",
  164390. "I0": "input",
  164391. "I1": "input"
  164392. },
  164393. "connections": {
  164394. "CI": [ "0" ],
  164395. "CO": [ 6862 ],
  164396. "I0": [ 6842 ],
  164397. "I1": [ 6861 ]
  164398. }
  164399. },
  164400. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_CARRY_I1_CO_SB_CARRY_CI": {
  164401. "hide_name": 0,
  164402. "type": "SB_CARRY",
  164403. "parameters": {
  164404. },
  164405. "attributes": {
  164406. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164407. },
  164408. "port_directions": {
  164409. "CI": "input",
  164410. "CO": "output",
  164411. "I0": "input",
  164412. "I1": "input"
  164413. },
  164414. "connections": {
  164415. "CI": [ 6862 ],
  164416. "CO": [ 6863 ],
  164417. "I0": [ 6840 ],
  164418. "I1": [ "0" ]
  164419. }
  164420. },
  164421. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2": {
  164422. "hide_name": 0,
  164423. "type": "SB_LUT4",
  164424. "parameters": {
  164425. "LUT_INIT": "0110100110010110"
  164426. },
  164427. "attributes": {
  164428. "module_not_derived": "00000000000000000000000000000001",
  164429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164430. },
  164431. "port_directions": {
  164432. "I0": "input",
  164433. "I1": "input",
  164434. "I2": "input",
  164435. "I3": "input",
  164436. "O": "output"
  164437. },
  164438. "connections": {
  164439. "I0": [ "0" ],
  164440. "I1": [ 6842 ],
  164441. "I2": [ 6861 ],
  164442. "I3": [ "0" ],
  164443. "O": [ 6841 ]
  164444. }
  164445. },
  164446. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O": {
  164447. "hide_name": 0,
  164448. "type": "SB_LUT4",
  164449. "parameters": {
  164450. "LUT_INIT": "0110100110010110"
  164451. },
  164452. "attributes": {
  164453. "module_not_derived": "00000000000000000000000000000001",
  164454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164455. },
  164456. "port_directions": {
  164457. "I0": "input",
  164458. "I1": "input",
  164459. "I2": "input",
  164460. "I3": "input",
  164461. "O": "output"
  164462. },
  164463. "connections": {
  164464. "I0": [ "0" ],
  164465. "I1": [ 6828 ],
  164466. "I2": [ "0" ],
  164467. "I3": [ 6864 ],
  164468. "O": [ 6827 ]
  164469. }
  164470. },
  164471. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_1": {
  164472. "hide_name": 0,
  164473. "type": "SB_LUT4",
  164474. "parameters": {
  164475. "LUT_INIT": "0110100110010110"
  164476. },
  164477. "attributes": {
  164478. "module_not_derived": "00000000000000000000000000000001",
  164479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164480. },
  164481. "port_directions": {
  164482. "I0": "input",
  164483. "I1": "input",
  164484. "I2": "input",
  164485. "I3": "input",
  164486. "O": "output"
  164487. },
  164488. "connections": {
  164489. "I0": [ "0" ],
  164490. "I1": [ 6852 ],
  164491. "I2": [ "0" ],
  164492. "I3": [ 6865 ],
  164493. "O": [ 6851 ]
  164494. }
  164495. },
  164496. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_10": {
  164497. "hide_name": 0,
  164498. "type": "SB_LUT4",
  164499. "parameters": {
  164500. "LUT_INIT": "0110100110010110"
  164501. },
  164502. "attributes": {
  164503. "module_not_derived": "00000000000000000000000000000001",
  164504. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164505. },
  164506. "port_directions": {
  164507. "I0": "input",
  164508. "I1": "input",
  164509. "I2": "input",
  164510. "I3": "input",
  164511. "O": "output"
  164512. },
  164513. "connections": {
  164514. "I0": [ "0" ],
  164515. "I1": [ 6834 ],
  164516. "I2": [ "0" ],
  164517. "I3": [ 6866 ],
  164518. "O": [ 6833 ]
  164519. }
  164520. },
  164521. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_CARRY_CO": {
  164522. "hide_name": 0,
  164523. "type": "SB_CARRY",
  164524. "parameters": {
  164525. },
  164526. "attributes": {
  164527. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164528. },
  164529. "port_directions": {
  164530. "CI": "input",
  164531. "CO": "output",
  164532. "I0": "input",
  164533. "I1": "input"
  164534. },
  164535. "connections": {
  164536. "CI": [ 6867 ],
  164537. "CO": [ 6866 ],
  164538. "I0": [ 6836 ],
  164539. "I1": [ "0" ]
  164540. }
  164541. },
  164542. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_11": {
  164543. "hide_name": 0,
  164544. "type": "SB_LUT4",
  164545. "parameters": {
  164546. "LUT_INIT": "0110100110010110"
  164547. },
  164548. "attributes": {
  164549. "module_not_derived": "00000000000000000000000000000001",
  164550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164551. },
  164552. "port_directions": {
  164553. "I0": "input",
  164554. "I1": "input",
  164555. "I2": "input",
  164556. "I3": "input",
  164557. "O": "output"
  164558. },
  164559. "connections": {
  164560. "I0": [ "0" ],
  164561. "I1": [ 6832 ],
  164562. "I2": [ "0" ],
  164563. "I3": [ 6868 ],
  164564. "O": [ 6831 ]
  164565. }
  164566. },
  164567. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_CARRY_CO": {
  164568. "hide_name": 0,
  164569. "type": "SB_CARRY",
  164570. "parameters": {
  164571. },
  164572. "attributes": {
  164573. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164574. },
  164575. "port_directions": {
  164576. "CI": "input",
  164577. "CO": "output",
  164578. "I0": "input",
  164579. "I1": "input"
  164580. },
  164581. "connections": {
  164582. "CI": [ 6866 ],
  164583. "CO": [ 6868 ],
  164584. "I0": [ 6834 ],
  164585. "I1": [ "0" ]
  164586. }
  164587. },
  164588. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_12": {
  164589. "hide_name": 0,
  164590. "type": "SB_LUT4",
  164591. "parameters": {
  164592. "LUT_INIT": "0110100110010110"
  164593. },
  164594. "attributes": {
  164595. "module_not_derived": "00000000000000000000000000000001",
  164596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164597. },
  164598. "port_directions": {
  164599. "I0": "input",
  164600. "I1": "input",
  164601. "I2": "input",
  164602. "I3": "input",
  164603. "O": "output"
  164604. },
  164605. "connections": {
  164606. "I0": [ "0" ],
  164607. "I1": [ 6858 ],
  164608. "I2": [ "0" ],
  164609. "I3": [ 6869 ],
  164610. "O": [ 6857 ]
  164611. }
  164612. },
  164613. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_CARRY_CO": {
  164614. "hide_name": 0,
  164615. "type": "SB_CARRY",
  164616. "parameters": {
  164617. },
  164618. "attributes": {
  164619. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164620. },
  164621. "port_directions": {
  164622. "CI": "input",
  164623. "CO": "output",
  164624. "I0": "input",
  164625. "I1": "input"
  164626. },
  164627. "connections": {
  164628. "CI": [ 6868 ],
  164629. "CO": [ 6869 ],
  164630. "I0": [ 6832 ],
  164631. "I1": [ "0" ]
  164632. }
  164633. },
  164634. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_13": {
  164635. "hide_name": 0,
  164636. "type": "SB_LUT4",
  164637. "parameters": {
  164638. "LUT_INIT": "0110100110010110"
  164639. },
  164640. "attributes": {
  164641. "module_not_derived": "00000000000000000000000000000001",
  164642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164643. },
  164644. "port_directions": {
  164645. "I0": "input",
  164646. "I1": "input",
  164647. "I2": "input",
  164648. "I3": "input",
  164649. "O": "output"
  164650. },
  164651. "connections": {
  164652. "I0": [ "0" ],
  164653. "I1": [ 6856 ],
  164654. "I2": [ "0" ],
  164655. "I3": [ 6870 ],
  164656. "O": [ 6855 ]
  164657. }
  164658. },
  164659. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_CARRY_CO": {
  164660. "hide_name": 0,
  164661. "type": "SB_CARRY",
  164662. "parameters": {
  164663. },
  164664. "attributes": {
  164665. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164666. },
  164667. "port_directions": {
  164668. "CI": "input",
  164669. "CO": "output",
  164670. "I0": "input",
  164671. "I1": "input"
  164672. },
  164673. "connections": {
  164674. "CI": [ 6869 ],
  164675. "CO": [ 6870 ],
  164676. "I0": [ 6858 ],
  164677. "I1": [ "0" ]
  164678. }
  164679. },
  164680. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_14": {
  164681. "hide_name": 0,
  164682. "type": "SB_LUT4",
  164683. "parameters": {
  164684. "LUT_INIT": "0110100110010110"
  164685. },
  164686. "attributes": {
  164687. "module_not_derived": "00000000000000000000000000000001",
  164688. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164689. },
  164690. "port_directions": {
  164691. "I0": "input",
  164692. "I1": "input",
  164693. "I2": "input",
  164694. "I3": "input",
  164695. "O": "output"
  164696. },
  164697. "connections": {
  164698. "I0": [ "0" ],
  164699. "I1": [ 6854 ],
  164700. "I2": [ "0" ],
  164701. "I3": [ 6871 ],
  164702. "O": [ 6853 ]
  164703. }
  164704. },
  164705. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_CARRY_CO": {
  164706. "hide_name": 0,
  164707. "type": "SB_CARRY",
  164708. "parameters": {
  164709. },
  164710. "attributes": {
  164711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164712. },
  164713. "port_directions": {
  164714. "CI": "input",
  164715. "CO": "output",
  164716. "I0": "input",
  164717. "I1": "input"
  164718. },
  164719. "connections": {
  164720. "CI": [ 6870 ],
  164721. "CO": [ 6871 ],
  164722. "I0": [ 6856 ],
  164723. "I1": [ "0" ]
  164724. }
  164725. },
  164726. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I3_SB_CARRY_CO": {
  164727. "hide_name": 0,
  164728. "type": "SB_CARRY",
  164729. "parameters": {
  164730. },
  164731. "attributes": {
  164732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164733. },
  164734. "port_directions": {
  164735. "CI": "input",
  164736. "CO": "output",
  164737. "I0": "input",
  164738. "I1": "input"
  164739. },
  164740. "connections": {
  164741. "CI": [ 6871 ],
  164742. "CO": [ 6865 ],
  164743. "I0": [ 6854 ],
  164744. "I1": [ "0" ]
  164745. }
  164746. },
  164747. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_2": {
  164748. "hide_name": 0,
  164749. "type": "SB_LUT4",
  164750. "parameters": {
  164751. "LUT_INIT": "0110100110010110"
  164752. },
  164753. "attributes": {
  164754. "module_not_derived": "00000000000000000000000000000001",
  164755. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164756. },
  164757. "port_directions": {
  164758. "I0": "input",
  164759. "I1": "input",
  164760. "I2": "input",
  164761. "I3": "input",
  164762. "O": "output"
  164763. },
  164764. "connections": {
  164765. "I0": [ "0" ],
  164766. "I1": [ 6850 ],
  164767. "I2": [ "0" ],
  164768. "I3": [ 6872 ],
  164769. "O": [ 6849 ]
  164770. }
  164771. },
  164772. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_2_I3_SB_CARRY_CO": {
  164773. "hide_name": 0,
  164774. "type": "SB_CARRY",
  164775. "parameters": {
  164776. },
  164777. "attributes": {
  164778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164779. },
  164780. "port_directions": {
  164781. "CI": "input",
  164782. "CO": "output",
  164783. "I0": "input",
  164784. "I1": "input"
  164785. },
  164786. "connections": {
  164787. "CI": [ 6865 ],
  164788. "CO": [ 6872 ],
  164789. "I0": [ 6852 ],
  164790. "I1": [ "0" ]
  164791. }
  164792. },
  164793. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_3": {
  164794. "hide_name": 0,
  164795. "type": "SB_LUT4",
  164796. "parameters": {
  164797. "LUT_INIT": "0110100110010110"
  164798. },
  164799. "attributes": {
  164800. "module_not_derived": "00000000000000000000000000000001",
  164801. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164802. },
  164803. "port_directions": {
  164804. "I0": "input",
  164805. "I1": "input",
  164806. "I2": "input",
  164807. "I3": "input",
  164808. "O": "output"
  164809. },
  164810. "connections": {
  164811. "I0": [ "0" ],
  164812. "I1": [ 6848 ],
  164813. "I2": [ "0" ],
  164814. "I3": [ 6873 ],
  164815. "O": [ 6847 ]
  164816. }
  164817. },
  164818. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_3_I3_SB_CARRY_CO": {
  164819. "hide_name": 0,
  164820. "type": "SB_CARRY",
  164821. "parameters": {
  164822. },
  164823. "attributes": {
  164824. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164825. },
  164826. "port_directions": {
  164827. "CI": "input",
  164828. "CO": "output",
  164829. "I0": "input",
  164830. "I1": "input"
  164831. },
  164832. "connections": {
  164833. "CI": [ 6872 ],
  164834. "CO": [ 6873 ],
  164835. "I0": [ 6850 ],
  164836. "I1": [ "0" ]
  164837. }
  164838. },
  164839. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_4": {
  164840. "hide_name": 0,
  164841. "type": "SB_LUT4",
  164842. "parameters": {
  164843. "LUT_INIT": "0110100110010110"
  164844. },
  164845. "attributes": {
  164846. "module_not_derived": "00000000000000000000000000000001",
  164847. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164848. },
  164849. "port_directions": {
  164850. "I0": "input",
  164851. "I1": "input",
  164852. "I2": "input",
  164853. "I3": "input",
  164854. "O": "output"
  164855. },
  164856. "connections": {
  164857. "I0": [ "0" ],
  164858. "I1": [ 6846 ],
  164859. "I2": [ "0" ],
  164860. "I3": [ 6874 ],
  164861. "O": [ 6845 ]
  164862. }
  164863. },
  164864. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_4_I3_SB_CARRY_CO": {
  164865. "hide_name": 0,
  164866. "type": "SB_CARRY",
  164867. "parameters": {
  164868. },
  164869. "attributes": {
  164870. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164871. },
  164872. "port_directions": {
  164873. "CI": "input",
  164874. "CO": "output",
  164875. "I0": "input",
  164876. "I1": "input"
  164877. },
  164878. "connections": {
  164879. "CI": [ 6873 ],
  164880. "CO": [ 6874 ],
  164881. "I0": [ 6848 ],
  164882. "I1": [ "0" ]
  164883. }
  164884. },
  164885. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_5": {
  164886. "hide_name": 0,
  164887. "type": "SB_LUT4",
  164888. "parameters": {
  164889. "LUT_INIT": "0110100110010110"
  164890. },
  164891. "attributes": {
  164892. "module_not_derived": "00000000000000000000000000000001",
  164893. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164894. },
  164895. "port_directions": {
  164896. "I0": "input",
  164897. "I1": "input",
  164898. "I2": "input",
  164899. "I3": "input",
  164900. "O": "output"
  164901. },
  164902. "connections": {
  164903. "I0": [ "0" ],
  164904. "I1": [ 6844 ],
  164905. "I2": [ "0" ],
  164906. "I3": [ 6875 ],
  164907. "O": [ 6843 ]
  164908. }
  164909. },
  164910. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_5_I3_SB_CARRY_CO": {
  164911. "hide_name": 0,
  164912. "type": "SB_CARRY",
  164913. "parameters": {
  164914. },
  164915. "attributes": {
  164916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164917. },
  164918. "port_directions": {
  164919. "CI": "input",
  164920. "CO": "output",
  164921. "I0": "input",
  164922. "I1": "input"
  164923. },
  164924. "connections": {
  164925. "CI": [ 6874 ],
  164926. "CO": [ 6875 ],
  164927. "I0": [ 6846 ],
  164928. "I1": [ "0" ]
  164929. }
  164930. },
  164931. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_6": {
  164932. "hide_name": 0,
  164933. "type": "SB_LUT4",
  164934. "parameters": {
  164935. "LUT_INIT": "0110100110010110"
  164936. },
  164937. "attributes": {
  164938. "module_not_derived": "00000000000000000000000000000001",
  164939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164940. },
  164941. "port_directions": {
  164942. "I0": "input",
  164943. "I1": "input",
  164944. "I2": "input",
  164945. "I3": "input",
  164946. "O": "output"
  164947. },
  164948. "connections": {
  164949. "I0": [ "0" ],
  164950. "I1": [ 6830 ],
  164951. "I2": [ "0" ],
  164952. "I3": [ 6876 ],
  164953. "O": [ 6829 ]
  164954. }
  164955. },
  164956. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_6_I3_SB_CARRY_CO": {
  164957. "hide_name": 0,
  164958. "type": "SB_CARRY",
  164959. "parameters": {
  164960. },
  164961. "attributes": {
  164962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  164963. },
  164964. "port_directions": {
  164965. "CI": "input",
  164966. "CO": "output",
  164967. "I0": "input",
  164968. "I1": "input"
  164969. },
  164970. "connections": {
  164971. "CI": [ 6875 ],
  164972. "CO": [ 6876 ],
  164973. "I0": [ 6844 ],
  164974. "I1": [ "0" ]
  164975. }
  164976. },
  164977. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_7": {
  164978. "hide_name": 0,
  164979. "type": "SB_LUT4",
  164980. "parameters": {
  164981. "LUT_INIT": "0110100110010110"
  164982. },
  164983. "attributes": {
  164984. "module_not_derived": "00000000000000000000000000000001",
  164985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  164986. },
  164987. "port_directions": {
  164988. "I0": "input",
  164989. "I1": "input",
  164990. "I2": "input",
  164991. "I3": "input",
  164992. "O": "output"
  164993. },
  164994. "connections": {
  164995. "I0": [ "0" ],
  164996. "I1": [ 6840 ],
  164997. "I2": [ "0" ],
  164998. "I3": [ 6862 ],
  164999. "O": [ 6839 ]
  165000. }
  165001. },
  165002. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_8": {
  165003. "hide_name": 0,
  165004. "type": "SB_LUT4",
  165005. "parameters": {
  165006. "LUT_INIT": "0110100110010110"
  165007. },
  165008. "attributes": {
  165009. "module_not_derived": "00000000000000000000000000000001",
  165010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165011. },
  165012. "port_directions": {
  165013. "I0": "input",
  165014. "I1": "input",
  165015. "I2": "input",
  165016. "I3": "input",
  165017. "O": "output"
  165018. },
  165019. "connections": {
  165020. "I0": [ "0" ],
  165021. "I1": [ 6838 ],
  165022. "I2": [ "0" ],
  165023. "I3": [ 6863 ],
  165024. "O": [ 6837 ]
  165025. }
  165026. },
  165027. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_9": {
  165028. "hide_name": 0,
  165029. "type": "SB_LUT4",
  165030. "parameters": {
  165031. "LUT_INIT": "0110100110010110"
  165032. },
  165033. "attributes": {
  165034. "module_not_derived": "00000000000000000000000000000001",
  165035. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165036. },
  165037. "port_directions": {
  165038. "I0": "input",
  165039. "I1": "input",
  165040. "I2": "input",
  165041. "I3": "input",
  165042. "O": "output"
  165043. },
  165044. "connections": {
  165045. "I0": [ "0" ],
  165046. "I1": [ 6836 ],
  165047. "I2": [ "0" ],
  165048. "I3": [ 6867 ],
  165049. "O": [ 6835 ]
  165050. }
  165051. },
  165052. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_9_I3_SB_CARRY_CO": {
  165053. "hide_name": 0,
  165054. "type": "SB_CARRY",
  165055. "parameters": {
  165056. },
  165057. "attributes": {
  165058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  165059. },
  165060. "port_directions": {
  165061. "CI": "input",
  165062. "CO": "output",
  165063. "I0": "input",
  165064. "I1": "input"
  165065. },
  165066. "connections": {
  165067. "CI": [ 6863 ],
  165068. "CO": [ 6867 ],
  165069. "I0": [ 6838 ],
  165070. "I1": [ "0" ]
  165071. }
  165072. },
  165073. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_CARRY_CO": {
  165074. "hide_name": 0,
  165075. "type": "SB_CARRY",
  165076. "parameters": {
  165077. },
  165078. "attributes": {
  165079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4"
  165080. },
  165081. "port_directions": {
  165082. "CI": "input",
  165083. "CO": "output",
  165084. "I0": "input",
  165085. "I1": "input"
  165086. },
  165087. "connections": {
  165088. "CI": [ 6876 ],
  165089. "CO": [ 6864 ],
  165090. "I0": [ 6830 ],
  165091. "I1": [ "0" ]
  165092. }
  165093. },
  165094. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_O": {
  165095. "hide_name": 0,
  165096. "type": "SB_LUT4",
  165097. "parameters": {
  165098. "LUT_INIT": "1111000000000000"
  165099. },
  165100. "attributes": {
  165101. "module_not_derived": "00000000000000000000000000000001",
  165102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  165103. },
  165104. "port_directions": {
  165105. "I0": "input",
  165106. "I1": "input",
  165107. "I2": "input",
  165108. "I3": "input",
  165109. "O": "output"
  165110. },
  165111. "connections": {
  165112. "I0": [ "0" ],
  165113. "I1": [ "0" ],
  165114. "I2": [ 6877 ],
  165115. "I3": [ 6878 ],
  165116. "O": [ 6861 ]
  165117. }
  165118. },
  165119. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_O_I2_SB_DFFR_Q": {
  165120. "hide_name": 0,
  165121. "type": "SB_DFFR",
  165122. "parameters": {
  165123. },
  165124. "attributes": {
  165125. "module_not_derived": "00000000000000000000000000000001",
  165126. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  165127. },
  165128. "port_directions": {
  165129. "C": "input",
  165130. "D": "input",
  165131. "Q": "output",
  165132. "R": "input"
  165133. },
  165134. "connections": {
  165135. "C": [ 42 ],
  165136. "D": [ 6879 ],
  165137. "Q": [ 6877 ],
  165138. "R": [ 127 ]
  165139. }
  165140. },
  165141. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_O_I2_SB_DFFR_Q_1": {
  165142. "hide_name": 0,
  165143. "type": "SB_DFFR",
  165144. "parameters": {
  165145. },
  165146. "attributes": {
  165147. "module_not_derived": "00000000000000000000000000000001",
  165148. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:179.2-196.6|/usr/bin/../share/yosys/ice40/ff_map.v:9.57-9.103"
  165149. },
  165150. "port_directions": {
  165151. "C": "input",
  165152. "D": "input",
  165153. "Q": "output",
  165154. "R": "input"
  165155. },
  165156. "connections": {
  165157. "C": [ 42 ],
  165158. "D": [ 6655 ],
  165159. "Q": [ 6878 ],
  165160. "R": [ 127 ]
  165161. }
  165162. },
  165163. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_O_I2_SB_DFFR_Q_D_SB_LUT4_O": {
  165164. "hide_name": 0,
  165165. "type": "SB_LUT4",
  165166. "parameters": {
  165167. "LUT_INIT": "1100000000000000"
  165168. },
  165169. "attributes": {
  165170. "module_not_derived": "00000000000000000000000000000001",
  165171. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165172. },
  165173. "port_directions": {
  165174. "I0": "input",
  165175. "I1": "input",
  165176. "I2": "input",
  165177. "I3": "input",
  165178. "O": "output"
  165179. },
  165180. "connections": {
  165181. "I0": [ "0" ],
  165182. "I1": [ 6650 ],
  165183. "I2": [ 6651 ],
  165184. "I3": [ 6654 ],
  165185. "O": [ 6879 ]
  165186. }
  165187. },
  165188. "vid_I.vs_in_vbl_SB_LUT4_I3": {
  165189. "hide_name": 0,
  165190. "type": "SB_LUT4",
  165191. "parameters": {
  165192. "LUT_INIT": "0100010101010101"
  165193. },
  165194. "attributes": {
  165195. "module_not_derived": "00000000000000000000000000000001",
  165196. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165197. },
  165198. "port_directions": {
  165199. "I0": "input",
  165200. "I1": "input",
  165201. "I2": "input",
  165202. "I3": "input",
  165203. "O": "output"
  165204. },
  165205. "connections": {
  165206. "I0": [ 5641 ],
  165207. "I1": [ 718 ],
  165208. "I2": [ 5980 ],
  165209. "I3": [ 6860 ],
  165210. "O": [ 6880 ]
  165211. }
  165212. },
  165213. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3": {
  165214. "hide_name": 0,
  165215. "type": "SB_LUT4",
  165216. "parameters": {
  165217. "LUT_INIT": "1100000011111111"
  165218. },
  165219. "attributes": {
  165220. "module_not_derived": "00000000000000000000000000000001",
  165221. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165222. },
  165223. "port_directions": {
  165224. "I0": "input",
  165225. "I1": "input",
  165226. "I2": "input",
  165227. "I3": "input",
  165228. "O": "output"
  165229. },
  165230. "connections": {
  165231. "I0": [ "0" ],
  165232. "I1": [ 6567 ],
  165233. "I2": [ 6479 ],
  165234. "I3": [ 6880 ],
  165235. "O": [ 863 ]
  165236. }
  165237. },
  165238. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O": {
  165239. "hide_name": 0,
  165240. "type": "SB_LUT4",
  165241. "parameters": {
  165242. "LUT_INIT": "1100000011111111"
  165243. },
  165244. "attributes": {
  165245. "module_not_derived": "00000000000000000000000000000001",
  165246. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165247. },
  165248. "port_directions": {
  165249. "I0": "input",
  165250. "I1": "input",
  165251. "I2": "input",
  165252. "I3": "input",
  165253. "O": "output"
  165254. },
  165255. "connections": {
  165256. "I0": [ "0" ],
  165257. "I1": [ 6546 ],
  165258. "I2": [ 6479 ],
  165259. "I3": [ 6881 ],
  165260. "O": [ 866 ]
  165261. }
  165262. },
  165263. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1": {
  165264. "hide_name": 0,
  165265. "type": "SB_LUT4",
  165266. "parameters": {
  165267. "LUT_INIT": "1100000011111111"
  165268. },
  165269. "attributes": {
  165270. "module_not_derived": "00000000000000000000000000000001",
  165271. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165272. },
  165273. "port_directions": {
  165274. "I0": "input",
  165275. "I1": "input",
  165276. "I2": "input",
  165277. "I3": "input",
  165278. "O": "output"
  165279. },
  165280. "connections": {
  165281. "I0": [ "0" ],
  165282. "I1": [ 6547 ],
  165283. "I2": [ 6479 ],
  165284. "I3": [ 6882 ],
  165285. "O": [ 865 ]
  165286. }
  165287. },
  165288. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_10": {
  165289. "hide_name": 0,
  165290. "type": "SB_LUT4",
  165291. "parameters": {
  165292. "LUT_INIT": "1111110011001100"
  165293. },
  165294. "attributes": {
  165295. "module_not_derived": "00000000000000000000000000000001",
  165296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165297. },
  165298. "port_directions": {
  165299. "I0": "input",
  165300. "I1": "input",
  165301. "I2": "input",
  165302. "I3": "input",
  165303. "O": "output"
  165304. },
  165305. "connections": {
  165306. "I0": [ "0" ],
  165307. "I1": [ 5663 ],
  165308. "I2": [ 6575 ],
  165309. "I3": [ 6479 ],
  165310. "O": [ 885 ]
  165311. }
  165312. },
  165313. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_11": {
  165314. "hide_name": 0,
  165315. "type": "SB_LUT4",
  165316. "parameters": {
  165317. "LUT_INIT": "1111110011110000"
  165318. },
  165319. "attributes": {
  165320. "module_not_derived": "00000000000000000000000000000001",
  165321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165322. },
  165323. "port_directions": {
  165324. "I0": "input",
  165325. "I1": "input",
  165326. "I2": "input",
  165327. "I3": "input",
  165328. "O": "output"
  165329. },
  165330. "connections": {
  165331. "I0": [ "0" ],
  165332. "I1": [ 6576 ],
  165333. "I2": [ 5662 ],
  165334. "I3": [ 6479 ],
  165335. "O": [ 884 ]
  165336. }
  165337. },
  165338. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_12": {
  165339. "hide_name": 0,
  165340. "type": "SB_LUT4",
  165341. "parameters": {
  165342. "LUT_INIT": "1111110011001100"
  165343. },
  165344. "attributes": {
  165345. "module_not_derived": "00000000000000000000000000000001",
  165346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165347. },
  165348. "port_directions": {
  165349. "I0": "input",
  165350. "I1": "input",
  165351. "I2": "input",
  165352. "I3": "input",
  165353. "O": "output"
  165354. },
  165355. "connections": {
  165356. "I0": [ "0" ],
  165357. "I1": [ 5661 ],
  165358. "I2": [ 6577 ],
  165359. "I3": [ 6479 ],
  165360. "O": [ 883 ]
  165361. }
  165362. },
  165363. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_13": {
  165364. "hide_name": 0,
  165365. "type": "SB_LUT4",
  165366. "parameters": {
  165367. "LUT_INIT": "1111110011001100"
  165368. },
  165369. "attributes": {
  165370. "module_not_derived": "00000000000000000000000000000001",
  165371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165372. },
  165373. "port_directions": {
  165374. "I0": "input",
  165375. "I1": "input",
  165376. "I2": "input",
  165377. "I3": "input",
  165378. "O": "output"
  165379. },
  165380. "connections": {
  165381. "I0": [ "0" ],
  165382. "I1": [ 5660 ],
  165383. "I2": [ 6578 ],
  165384. "I3": [ 6479 ],
  165385. "O": [ 882 ]
  165386. }
  165387. },
  165388. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_14": {
  165389. "hide_name": 0,
  165390. "type": "SB_LUT4",
  165391. "parameters": {
  165392. "LUT_INIT": "1100000011111111"
  165393. },
  165394. "attributes": {
  165395. "module_not_derived": "00000000000000000000000000000001",
  165396. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165397. },
  165398. "port_directions": {
  165399. "I0": "input",
  165400. "I1": "input",
  165401. "I2": "input",
  165402. "I3": "input",
  165403. "O": "output"
  165404. },
  165405. "connections": {
  165406. "I0": [ "0" ],
  165407. "I1": [ 6545 ],
  165408. "I2": [ 6479 ],
  165409. "I3": [ 6883 ],
  165410. "O": [ 867 ]
  165411. }
  165412. },
  165413. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_14_I3_SB_LUT4_O": {
  165414. "hide_name": 0,
  165415. "type": "SB_LUT4",
  165416. "parameters": {
  165417. "LUT_INIT": "0010001100110011"
  165418. },
  165419. "attributes": {
  165420. "module_not_derived": "00000000000000000000000000000001",
  165421. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165422. },
  165423. "port_directions": {
  165424. "I0": "input",
  165425. "I1": "input",
  165426. "I2": "input",
  165427. "I3": "input",
  165428. "O": "output"
  165429. },
  165430. "connections": {
  165431. "I0": [ 718 ],
  165432. "I1": [ 5642 ],
  165433. "I2": [ 5980 ],
  165434. "I3": [ 6846 ],
  165435. "O": [ 6883 ]
  165436. }
  165437. },
  165438. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3_SB_LUT4_O": {
  165439. "hide_name": 0,
  165440. "type": "SB_LUT4",
  165441. "parameters": {
  165442. "LUT_INIT": "0010001100110011"
  165443. },
  165444. "attributes": {
  165445. "module_not_derived": "00000000000000000000000000000001",
  165446. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165447. },
  165448. "port_directions": {
  165449. "I0": "input",
  165450. "I1": "input",
  165451. "I2": "input",
  165452. "I3": "input",
  165453. "O": "output"
  165454. },
  165455. "connections": {
  165456. "I0": [ 718 ],
  165457. "I1": [ 5650 ],
  165458. "I2": [ 5980 ],
  165459. "I3": [ 6830 ],
  165460. "O": [ 6882 ]
  165461. }
  165462. },
  165463. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2": {
  165464. "hide_name": 0,
  165465. "type": "SB_LUT4",
  165466. "parameters": {
  165467. "LUT_INIT": "1100000011111111"
  165468. },
  165469. "attributes": {
  165470. "module_not_derived": "00000000000000000000000000000001",
  165471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165472. },
  165473. "port_directions": {
  165474. "I0": "input",
  165475. "I1": "input",
  165476. "I2": "input",
  165477. "I3": "input",
  165478. "O": "output"
  165479. },
  165480. "connections": {
  165481. "I0": [ "0" ],
  165482. "I1": [ 6548 ],
  165483. "I2": [ 6479 ],
  165484. "I3": [ 6884 ],
  165485. "O": [ 864 ]
  165486. }
  165487. },
  165488. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2_I3_SB_LUT4_O": {
  165489. "hide_name": 0,
  165490. "type": "SB_LUT4",
  165491. "parameters": {
  165492. "LUT_INIT": "0100010101010101"
  165493. },
  165494. "attributes": {
  165495. "module_not_derived": "00000000000000000000000000000001",
  165496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165497. },
  165498. "port_directions": {
  165499. "I0": "input",
  165500. "I1": "input",
  165501. "I2": "input",
  165502. "I3": "input",
  165503. "O": "output"
  165504. },
  165505. "connections": {
  165506. "I0": [ 5649 ],
  165507. "I1": [ 718 ],
  165508. "I2": [ 5980 ],
  165509. "I3": [ 6828 ],
  165510. "O": [ 6884 ]
  165511. }
  165512. },
  165513. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3": {
  165514. "hide_name": 0,
  165515. "type": "SB_LUT4",
  165516. "parameters": {
  165517. "LUT_INIT": "1111110011110000"
  165518. },
  165519. "attributes": {
  165520. "module_not_derived": "00000000000000000000000000000001",
  165521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165522. },
  165523. "port_directions": {
  165524. "I0": "input",
  165525. "I1": "input",
  165526. "I2": "input",
  165527. "I3": "input",
  165528. "O": "output"
  165529. },
  165530. "connections": {
  165531. "I0": [ "0" ],
  165532. "I1": [ 6568 ],
  165533. "I2": [ 5640 ],
  165534. "I3": [ 6479 ],
  165535. "O": [ 862 ]
  165536. }
  165537. },
  165538. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4": {
  165539. "hide_name": 0,
  165540. "type": "SB_LUT4",
  165541. "parameters": {
  165542. "LUT_INIT": "1111110011001100"
  165543. },
  165544. "attributes": {
  165545. "module_not_derived": "00000000000000000000000000000001",
  165546. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165547. },
  165548. "port_directions": {
  165549. "I0": "input",
  165550. "I1": "input",
  165551. "I2": "input",
  165552. "I3": "input",
  165553. "O": "output"
  165554. },
  165555. "connections": {
  165556. "I0": [ "0" ],
  165557. "I1": [ 5639 ],
  165558. "I2": [ 6569 ],
  165559. "I3": [ 6479 ],
  165560. "O": [ 861 ]
  165561. }
  165562. },
  165563. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5": {
  165564. "hide_name": 0,
  165565. "type": "SB_LUT4",
  165566. "parameters": {
  165567. "LUT_INIT": "1111110011110000"
  165568. },
  165569. "attributes": {
  165570. "module_not_derived": "00000000000000000000000000000001",
  165571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165572. },
  165573. "port_directions": {
  165574. "I0": "input",
  165575. "I1": "input",
  165576. "I2": "input",
  165577. "I3": "input",
  165578. "O": "output"
  165579. },
  165580. "connections": {
  165581. "I0": [ "0" ],
  165582. "I1": [ 6570 ],
  165583. "I2": [ 5638 ],
  165584. "I3": [ 6479 ],
  165585. "O": [ 860 ]
  165586. }
  165587. },
  165588. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6": {
  165589. "hide_name": 0,
  165590. "type": "SB_LUT4",
  165591. "parameters": {
  165592. "LUT_INIT": "1111110011001100"
  165593. },
  165594. "attributes": {
  165595. "module_not_derived": "00000000000000000000000000000001",
  165596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165597. },
  165598. "port_directions": {
  165599. "I0": "input",
  165600. "I1": "input",
  165601. "I2": "input",
  165602. "I3": "input",
  165603. "O": "output"
  165604. },
  165605. "connections": {
  165606. "I0": [ "0" ],
  165607. "I1": [ 5637 ],
  165608. "I2": [ 6571 ],
  165609. "I3": [ 6479 ],
  165610. "O": [ 859 ]
  165611. }
  165612. },
  165613. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7": {
  165614. "hide_name": 0,
  165615. "type": "SB_LUT4",
  165616. "parameters": {
  165617. "LUT_INIT": "1111110011110000"
  165618. },
  165619. "attributes": {
  165620. "module_not_derived": "00000000000000000000000000000001",
  165621. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165622. },
  165623. "port_directions": {
  165624. "I0": "input",
  165625. "I1": "input",
  165626. "I2": "input",
  165627. "I3": "input",
  165628. "O": "output"
  165629. },
  165630. "connections": {
  165631. "I0": [ "0" ],
  165632. "I1": [ 6572 ],
  165633. "I2": [ 5636 ],
  165634. "I3": [ 6479 ],
  165635. "O": [ 858 ]
  165636. }
  165637. },
  165638. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8": {
  165639. "hide_name": 0,
  165640. "type": "SB_LUT4",
  165641. "parameters": {
  165642. "LUT_INIT": "1111110011001100"
  165643. },
  165644. "attributes": {
  165645. "module_not_derived": "00000000000000000000000000000001",
  165646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165647. },
  165648. "port_directions": {
  165649. "I0": "input",
  165650. "I1": "input",
  165651. "I2": "input",
  165652. "I3": "input",
  165653. "O": "output"
  165654. },
  165655. "connections": {
  165656. "I0": [ "0" ],
  165657. "I1": [ 5665 ],
  165658. "I2": [ 6573 ],
  165659. "I3": [ 6479 ],
  165660. "O": [ 887 ]
  165661. }
  165662. },
  165663. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_9": {
  165664. "hide_name": 0,
  165665. "type": "SB_LUT4",
  165666. "parameters": {
  165667. "LUT_INIT": "1111110011001100"
  165668. },
  165669. "attributes": {
  165670. "module_not_derived": "00000000000000000000000000000001",
  165671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  165672. },
  165673. "port_directions": {
  165674. "I0": "input",
  165675. "I1": "input",
  165676. "I2": "input",
  165677. "I3": "input",
  165678. "O": "output"
  165679. },
  165680. "connections": {
  165681. "I0": [ "0" ],
  165682. "I1": [ 5664 ],
  165683. "I2": [ 6574 ],
  165684. "I3": [ 6479 ],
  165685. "O": [ 886 ]
  165686. }
  165687. },
  165688. "vid_I.wb_ack_SB_DFF_Q": {
  165689. "hide_name": 0,
  165690. "type": "SB_DFF",
  165691. "parameters": {
  165692. },
  165693. "attributes": {
  165694. "module_not_derived": "00000000000000000000000000000001",
  165695. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:303.2-304.60|/usr/bin/../share/yosys/ice40/ff_map.v:2.51-2.90"
  165696. },
  165697. "port_directions": {
  165698. "C": "input",
  165699. "D": "input",
  165700. "Q": "output"
  165701. },
  165702. "connections": {
  165703. "C": [ 42 ],
  165704. "D": [ 6885 ],
  165705. "Q": [ 5980 ]
  165706. }
  165707. },
  165708. "vid_I.wb_ack_SB_LUT4_I1": {
  165709. "hide_name": 0,
  165710. "type": "SB_LUT4",
  165711. "parameters": {
  165712. "LUT_INIT": "0000101100001111"
  165713. },
  165714. "attributes": {
  165715. "module_not_derived": "00000000000000000000000000000001",
  165716. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165717. },
  165718. "port_directions": {
  165719. "I0": "input",
  165720. "I1": "input",
  165721. "I2": "input",
  165722. "I3": "input",
  165723. "O": "output"
  165724. },
  165725. "connections": {
  165726. "I0": [ 718 ],
  165727. "I1": [ 5980 ],
  165728. "I2": [ 5659 ],
  165729. "I3": [ 6842 ],
  165730. "O": [ 6490 ]
  165731. }
  165732. },
  165733. "vid_I.wb_ack_SB_LUT4_I2": {
  165734. "hide_name": 0,
  165735. "type": "SB_LUT4",
  165736. "parameters": {
  165737. "LUT_INIT": "0010001100110011"
  165738. },
  165739. "attributes": {
  165740. "module_not_derived": "00000000000000000000000000000001",
  165741. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165742. },
  165743. "port_directions": {
  165744. "I0": "input",
  165745. "I1": "input",
  165746. "I2": "input",
  165747. "I3": "input",
  165748. "O": "output"
  165749. },
  165750. "connections": {
  165751. "I0": [ 718 ],
  165752. "I1": [ 5652 ],
  165753. "I2": [ 5980 ],
  165754. "I3": [ 6848 ],
  165755. "O": [ 6484 ]
  165756. }
  165757. },
  165758. "vid_I.wb_ack_SB_LUT4_I2_1": {
  165759. "hide_name": 0,
  165760. "type": "SB_LUT4",
  165761. "parameters": {
  165762. "LUT_INIT": "0010001100110011"
  165763. },
  165764. "attributes": {
  165765. "module_not_derived": "00000000000000000000000000000001",
  165766. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165767. },
  165768. "port_directions": {
  165769. "I0": "input",
  165770. "I1": "input",
  165771. "I2": "input",
  165772. "I3": "input",
  165773. "O": "output"
  165774. },
  165775. "connections": {
  165776. "I0": [ 718 ],
  165777. "I1": [ 5653 ],
  165778. "I2": [ 5980 ],
  165779. "I3": [ 6850 ],
  165780. "O": [ 6506 ]
  165781. }
  165782. },
  165783. "vid_I.wb_ack_SB_LUT4_I2_10": {
  165784. "hide_name": 0,
  165785. "type": "SB_LUT4",
  165786. "parameters": {
  165787. "LUT_INIT": "0010001100110011"
  165788. },
  165789. "attributes": {
  165790. "module_not_derived": "00000000000000000000000000000001",
  165791. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165792. },
  165793. "port_directions": {
  165794. "I0": "input",
  165795. "I1": "input",
  165796. "I2": "input",
  165797. "I3": "input",
  165798. "O": "output"
  165799. },
  165800. "connections": {
  165801. "I0": [ 718 ],
  165802. "I1": [ 5658 ],
  165803. "I2": [ 5980 ],
  165804. "I3": [ 6840 ],
  165805. "O": [ 6480 ]
  165806. }
  165807. },
  165808. "vid_I.wb_ack_SB_LUT4_I2_11": {
  165809. "hide_name": 0,
  165810. "type": "SB_LUT4",
  165811. "parameters": {
  165812. "LUT_INIT": "0010001100110011"
  165813. },
  165814. "attributes": {
  165815. "module_not_derived": "00000000000000000000000000000001",
  165816. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165817. },
  165818. "port_directions": {
  165819. "I0": "input",
  165820. "I1": "input",
  165821. "I2": "input",
  165822. "I3": "input",
  165823. "O": "output"
  165824. },
  165825. "connections": {
  165826. "I0": [ 718 ],
  165827. "I1": [ 5651 ],
  165828. "I2": [ 5980 ],
  165829. "I3": [ 6844 ],
  165830. "O": [ 6881 ]
  165831. }
  165832. },
  165833. "vid_I.wb_ack_SB_LUT4_I2_2": {
  165834. "hide_name": 0,
  165835. "type": "SB_LUT4",
  165836. "parameters": {
  165837. "LUT_INIT": "0010001100110011"
  165838. },
  165839. "attributes": {
  165840. "module_not_derived": "00000000000000000000000000000001",
  165841. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165842. },
  165843. "port_directions": {
  165844. "I0": "input",
  165845. "I1": "input",
  165846. "I2": "input",
  165847. "I3": "input",
  165848. "O": "output"
  165849. },
  165850. "connections": {
  165851. "I0": [ 718 ],
  165852. "I1": [ 5643 ],
  165853. "I2": [ 5980 ],
  165854. "I3": [ 6852 ],
  165855. "O": [ 6504 ]
  165856. }
  165857. },
  165858. "vid_I.wb_ack_SB_LUT4_I2_3": {
  165859. "hide_name": 0,
  165860. "type": "SB_LUT4",
  165861. "parameters": {
  165862. "LUT_INIT": "0010001100110011"
  165863. },
  165864. "attributes": {
  165865. "module_not_derived": "00000000000000000000000000000001",
  165866. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165867. },
  165868. "port_directions": {
  165869. "I0": "input",
  165870. "I1": "input",
  165871. "I2": "input",
  165872. "I3": "input",
  165873. "O": "output"
  165874. },
  165875. "connections": {
  165876. "I0": [ 718 ],
  165877. "I1": [ 5644 ],
  165878. "I2": [ 5980 ],
  165879. "I3": [ 6854 ],
  165880. "O": [ 6502 ]
  165881. }
  165882. },
  165883. "vid_I.wb_ack_SB_LUT4_I2_4": {
  165884. "hide_name": 0,
  165885. "type": "SB_LUT4",
  165886. "parameters": {
  165887. "LUT_INIT": "0010001100110011"
  165888. },
  165889. "attributes": {
  165890. "module_not_derived": "00000000000000000000000000000001",
  165891. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165892. },
  165893. "port_directions": {
  165894. "I0": "input",
  165895. "I1": "input",
  165896. "I2": "input",
  165897. "I3": "input",
  165898. "O": "output"
  165899. },
  165900. "connections": {
  165901. "I0": [ 718 ],
  165902. "I1": [ 5645 ],
  165903. "I2": [ 5980 ],
  165904. "I3": [ 6856 ],
  165905. "O": [ 6500 ]
  165906. }
  165907. },
  165908. "vid_I.wb_ack_SB_LUT4_I2_5": {
  165909. "hide_name": 0,
  165910. "type": "SB_LUT4",
  165911. "parameters": {
  165912. "LUT_INIT": "0010001100110011"
  165913. },
  165914. "attributes": {
  165915. "module_not_derived": "00000000000000000000000000000001",
  165916. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165917. },
  165918. "port_directions": {
  165919. "I0": "input",
  165920. "I1": "input",
  165921. "I2": "input",
  165922. "I3": "input",
  165923. "O": "output"
  165924. },
  165925. "connections": {
  165926. "I0": [ 718 ],
  165927. "I1": [ 5647 ],
  165928. "I2": [ 5980 ],
  165929. "I3": [ 6858 ],
  165930. "O": [ 6498 ]
  165931. }
  165932. },
  165933. "vid_I.wb_ack_SB_LUT4_I2_6": {
  165934. "hide_name": 0,
  165935. "type": "SB_LUT4",
  165936. "parameters": {
  165937. "LUT_INIT": "0010001100110011"
  165938. },
  165939. "attributes": {
  165940. "module_not_derived": "00000000000000000000000000000001",
  165941. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165942. },
  165943. "port_directions": {
  165944. "I0": "input",
  165945. "I1": "input",
  165946. "I2": "input",
  165947. "I3": "input",
  165948. "O": "output"
  165949. },
  165950. "connections": {
  165951. "I0": [ 718 ],
  165952. "I1": [ 5654 ],
  165953. "I2": [ 5980 ],
  165954. "I3": [ 6832 ],
  165955. "O": [ 6496 ]
  165956. }
  165957. },
  165958. "vid_I.wb_ack_SB_LUT4_I2_7": {
  165959. "hide_name": 0,
  165960. "type": "SB_LUT4",
  165961. "parameters": {
  165962. "LUT_INIT": "0010001100110011"
  165963. },
  165964. "attributes": {
  165965. "module_not_derived": "00000000000000000000000000000001",
  165966. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165967. },
  165968. "port_directions": {
  165969. "I0": "input",
  165970. "I1": "input",
  165971. "I2": "input",
  165972. "I3": "input",
  165973. "O": "output"
  165974. },
  165975. "connections": {
  165976. "I0": [ 718 ],
  165977. "I1": [ 5655 ],
  165978. "I2": [ 5980 ],
  165979. "I3": [ 6834 ],
  165980. "O": [ 6494 ]
  165981. }
  165982. },
  165983. "vid_I.wb_ack_SB_LUT4_I2_8": {
  165984. "hide_name": 0,
  165985. "type": "SB_LUT4",
  165986. "parameters": {
  165987. "LUT_INIT": "0010001100110011"
  165988. },
  165989. "attributes": {
  165990. "module_not_derived": "00000000000000000000000000000001",
  165991. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  165992. },
  165993. "port_directions": {
  165994. "I0": "input",
  165995. "I1": "input",
  165996. "I2": "input",
  165997. "I3": "input",
  165998. "O": "output"
  165999. },
  166000. "connections": {
  166001. "I0": [ 718 ],
  166002. "I1": [ 5648 ],
  166003. "I2": [ 5980 ],
  166004. "I3": [ 6836 ],
  166005. "O": [ 6492 ]
  166006. }
  166007. },
  166008. "vid_I.wb_ack_SB_LUT4_I2_9": {
  166009. "hide_name": 0,
  166010. "type": "SB_LUT4",
  166011. "parameters": {
  166012. "LUT_INIT": "0010001100110011"
  166013. },
  166014. "attributes": {
  166015. "module_not_derived": "00000000000000000000000000000001",
  166016. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  166017. },
  166018. "port_directions": {
  166019. "I0": "input",
  166020. "I1": "input",
  166021. "I2": "input",
  166022. "I3": "input",
  166023. "O": "output"
  166024. },
  166025. "connections": {
  166026. "I0": [ 718 ],
  166027. "I1": [ 5656 ],
  166028. "I2": [ 5980 ],
  166029. "I3": [ 6838 ],
  166030. "O": [ 6482 ]
  166031. }
  166032. },
  166033. "vid_I.wb_ack_SB_LUT4_I3": {
  166034. "hide_name": 0,
  166035. "type": "SB_LUT4",
  166036. "parameters": {
  166037. "LUT_INIT": "1111000000000000"
  166038. },
  166039. "attributes": {
  166040. "module_not_derived": "00000000000000000000000000000001",
  166041. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:17.34-18.52"
  166042. },
  166043. "port_directions": {
  166044. "I0": "input",
  166045. "I1": "input",
  166046. "I2": "input",
  166047. "I3": "input",
  166048. "O": "output"
  166049. },
  166050. "connections": {
  166051. "I0": [ "0" ],
  166052. "I1": [ "0" ],
  166053. "I2": [ 718 ],
  166054. "I3": [ 5980 ],
  166055. "O": [ 6479 ]
  166056. }
  166057. },
  166058. "vid_I.wb_cyc_SB_DFFSR_Q": {
  166059. "hide_name": 0,
  166060. "type": "SB_DFFSR",
  166061. "parameters": {
  166062. },
  166063. "attributes": {
  166064. "module_not_derived": "00000000000000000000000000000001",
  166065. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:294.2-302.5|/usr/bin/../share/yosys/ice40/ff_map.v:19.59-19.105"
  166066. },
  166067. "port_directions": {
  166068. "C": "input",
  166069. "D": "input",
  166070. "Q": "output",
  166071. "R": "input"
  166072. },
  166073. "connections": {
  166074. "C": [ 42 ],
  166075. "D": [ 6886 ],
  166076. "Q": [ 6887 ],
  166077. "R": [ 127 ]
  166078. }
  166079. },
  166080. "vid_I.wb_cyc_SB_LUT4_I1": {
  166081. "hide_name": 0,
  166082. "type": "SB_LUT4",
  166083. "parameters": {
  166084. "LUT_INIT": "1111111100001100"
  166085. },
  166086. "attributes": {
  166087. "module_not_derived": "00000000000000000000000000000001",
  166088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  166089. },
  166090. "port_directions": {
  166091. "I0": "input",
  166092. "I1": "input",
  166093. "I2": "input",
  166094. "I3": "input",
  166095. "O": "output"
  166096. },
  166097. "connections": {
  166098. "I0": [ "0" ],
  166099. "I1": [ 6887 ],
  166100. "I2": [ 5980 ],
  166101. "I3": [ 6888 ],
  166102. "O": [ 6886 ]
  166103. }
  166104. },
  166105. "vid_I.wb_cyc_SB_LUT4_I1_1": {
  166106. "hide_name": 0,
  166107. "type": "SB_LUT4",
  166108. "parameters": {
  166109. "LUT_INIT": "0000010000001100"
  166110. },
  166111. "attributes": {
  166112. "module_not_derived": "00000000000000000000000000000001",
  166113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:26.33-27.52"
  166114. },
  166115. "port_directions": {
  166116. "I0": "input",
  166117. "I1": "input",
  166118. "I2": "input",
  166119. "I3": "input",
  166120. "O": "output"
  166121. },
  166122. "connections": {
  166123. "I0": [ 718 ],
  166124. "I1": [ 6887 ],
  166125. "I2": [ 5980 ],
  166126. "I3": [ 6551 ],
  166127. "O": [ 6885 ]
  166128. }
  166129. },
  166130. "vid_I.wb_cyc_SB_LUT4_I1_2": {
  166131. "hide_name": 0,
  166132. "type": "SB_LUT4",
  166133. "parameters": {
  166134. "LUT_INIT": "0000110000000000"
  166135. },
  166136. "attributes": {
  166137. "module_not_derived": "00000000000000000000000000000001",
  166138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  166139. },
  166140. "port_directions": {
  166141. "I0": "input",
  166142. "I1": "input",
  166143. "I2": "input",
  166144. "I3": "input",
  166145. "O": "output"
  166146. },
  166147. "connections": {
  166148. "I0": [ "0" ],
  166149. "I1": [ 6887 ],
  166150. "I2": [ 5980 ],
  166151. "I3": [ 469 ],
  166152. "O": [ 6566 ]
  166153. }
  166154. },
  166155. "vid_I.wb_cyc_SB_LUT4_I1_I3_SB_LUT4_O": {
  166156. "hide_name": 0,
  166157. "type": "SB_LUT4",
  166158. "parameters": {
  166159. "LUT_INIT": "0011000000000000"
  166160. },
  166161. "attributes": {
  166162. "module_not_derived": "00000000000000000000000000000001",
  166163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:22.34-23.52"
  166164. },
  166165. "port_directions": {
  166166. "I0": "input",
  166167. "I1": "input",
  166168. "I2": "input",
  166169. "I3": "input",
  166170. "O": "output"
  166171. },
  166172. "connections": {
  166173. "I0": [ "0" ],
  166174. "I1": [ 689 ],
  166175. "I2": [ 687 ],
  166176. "I3": [ 5632 ],
  166177. "O": [ 6888 ]
  166178. }
  166179. }
  166180. },
  166181. "netnames": {
  166182. "bram_I.addr": {
  166183. "hide_name": 0,
  166184. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41 ],
  166185. "attributes": {
  166186. "hdlname": "bram_I addr",
  166187. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/soc_bram.v:16.23-16.27"
  166188. }
  166189. },
  166190. "bram_I.clk": {
  166191. "hide_name": 0,
  166192. "bits": [ 42 ],
  166193. "attributes": {
  166194. "hdlname": "bram_I clk",
  166195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/soc_bram.v:21.23-21.26"
  166196. }
  166197. },
  166198. "bram_I.mem.0.0_WCLKE": {
  166199. "hide_name": 0,
  166200. "bits": [ 59 ],
  166201. "attributes": {
  166202. "defaultvalue": "1",
  166203. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  166204. }
  166205. },
  166206. "bram_I.mem.0.1_WCLKE": {
  166207. "hide_name": 0,
  166208. "bits": [ 94 ],
  166209. "attributes": {
  166210. "defaultvalue": "1",
  166211. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  166212. }
  166213. },
  166214. "bram_I.rdata": {
  166215. "hide_name": 0,
  166216. "bits": [ 43, 51, 47, 55, 45, 53, 49, 57, 44, 52, 48, 56, 46, 54, 50, 58, 78, 86, 82, 90, 80, 88, 84, 92, 79, 87, 83, 91, 81, 89, 85, 93 ],
  166217. "attributes": {
  166218. "hdlname": "bram_I rdata",
  166219. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/soc_bram.v:17.23-17.28"
  166220. }
  166221. },
  166222. "bram_I.wdata": {
  166223. "hide_name": 0,
  166224. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  166225. "attributes": {
  166226. "hdlname": "bram_I wdata",
  166227. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/soc_bram.v:18.23-18.28"
  166228. }
  166229. },
  166230. "btn": {
  166231. "hide_name": 0,
  166232. "bits": [ 27 ],
  166233. "attributes": {
  166234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:32.14-32.17"
  166235. }
  166236. },
  166237. "cache_I.age_next.w": {
  166238. "hide_name": 0,
  166239. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  166240. "signed": 1,
  166241. "attributes": {
  166242. "hdlname": "cache_I age_next.w",
  166243. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:398.11-398.12"
  166244. }
  166245. },
  166246. "cache_I.clk": {
  166247. "hide_name": 0,
  166248. "bits": [ 42 ],
  166249. "attributes": {
  166250. "hdlname": "cache_I clk",
  166251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:51.14-51.17"
  166252. }
  166253. },
  166254. "cache_I.cnt_ofs": {
  166255. "hide_name": 0,
  166256. "bits": [ 117, 115, 112 ],
  166257. "attributes": {
  166258. "hdlname": "cache_I cnt_ofs",
  166259. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:103.14-103.21"
  166260. }
  166261. },
  166262. "cache_I.cnt_ofs_SB_DFFSR_Q_1_D": {
  166263. "hide_name": 0,
  166264. "bits": [ 114 ],
  166265. "attributes": {
  166266. }
  166267. },
  166268. "cache_I.cnt_ofs_SB_DFFSR_Q_2_D": {
  166269. "hide_name": 0,
  166270. "bits": [ 118 ],
  166271. "attributes": {
  166272. }
  166273. },
  166274. "cache_I.cnt_ofs_SB_DFFSR_Q_D": {
  166275. "hide_name": 0,
  166276. "bits": [ 111 ],
  166277. "attributes": {
  166278. }
  166279. },
  166280. "cache_I.cnt_ofs_SB_DFFSR_Q_D_SB_LUT4_O_I0": {
  166281. "hide_name": 0,
  166282. "bits": [ 117, 116 ],
  166283. "attributes": {
  166284. "force_downto": "00000000000000000000000000000001",
  166285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166286. }
  166287. },
  166288. "cache_I.cnt_ofs_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  166289. "hide_name": 0,
  166290. "bits": [ 119 ],
  166291. "attributes": {
  166292. "abc9_carry": "00000000000000000000000000000001",
  166293. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:224.15-224.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  166294. }
  166295. },
  166296. "cache_I.cnt_ofs_SB_DFFSR_Q_R": {
  166297. "hide_name": 0,
  166298. "bits": [ 113 ],
  166299. "attributes": {
  166300. }
  166301. },
  166302. "cache_I.ctrl_bus_mode": {
  166303. "hide_name": 0,
  166304. "bits": [ 125 ],
  166305. "attributes": {
  166306. "hdlname": "cache_I ctrl_bus_mode",
  166307. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:99.14-99.27"
  166308. }
  166309. },
  166310. "cache_I.ctrl_state_nxt": {
  166311. "hide_name": 0,
  166312. "bits": [ 128, 126 ],
  166313. "attributes": {
  166314. "hdlname": "cache_I ctrl_state_nxt",
  166315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:97.14-97.28"
  166316. }
  166317. },
  166318. "cache_I.ctrl_state_nxt_SB_DFFR_D_Q": {
  166319. "hide_name": 0,
  166320. "bits": [ 123, 124 ],
  166321. "attributes": {
  166322. "force_downto": "00000000000000000000000000000001",
  166323. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166324. }
  166325. },
  166326. "cache_I.ctrl_state_nxt_SB_LUT4_O_1_I2": {
  166327. "hide_name": 0,
  166328. "bits": [ 131, 132 ],
  166329. "attributes": {
  166330. "force_downto": "00000000000000000000000000000001",
  166331. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166332. }
  166333. },
  166334. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2": {
  166335. "hide_name": 0,
  166336. "bits": [ 129, 130 ],
  166337. "attributes": {
  166338. "force_downto": "00000000000000000000000000000001",
  166339. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166340. }
  166341. },
  166342. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O_1_I3": {
  166343. "hide_name": 0,
  166344. "bits": [ 135, 136, 137, 138 ],
  166345. "attributes": {
  166346. "force_downto": "00000000000000000000000000000001",
  166347. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166348. }
  166349. },
  166350. "cache_I.ctrl_state_nxt_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I1": {
  166351. "hide_name": 0,
  166352. "bits": [ 139, 140, 141, 142 ],
  166353. "attributes": {
  166354. "force_downto": "00000000000000000000000000000001",
  166355. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166356. }
  166357. },
  166358. "cache_I.ctrl_tagram_we": {
  166359. "hide_name": 0,
  166360. "bits": [ 465 ],
  166361. "attributes": {
  166362. "hdlname": "cache_I ctrl_tagram_we",
  166363. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:100.14-100.28"
  166364. }
  166365. },
  166366. "cache_I.data_ram_I.addr": {
  166367. "hide_name": 0,
  166368. "bits": [ 6889, 6890, 6891, 152, 153, 154, 155, 156, 157, 158, 159, 160, 6892, 6893 ],
  166369. "attributes": {
  166370. "hdlname": "cache_I data_ram_I addr",
  166371. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:23.21-23.25",
  166372. "unused_bits": "0 1 2 12 13"
  166373. }
  166374. },
  166375. "cache_I.data_ram_I.clk": {
  166376. "hide_name": 0,
  166377. "bits": [ 42 ],
  166378. "attributes": {
  166379. "hdlname": "cache_I data_ram_I clk",
  166380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:29.21-29.24"
  166381. }
  166382. },
  166383. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS": {
  166384. "hide_name": 0,
  166385. "bits": [ 162 ],
  166386. "attributes": {
  166387. }
  166388. },
  166389. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_1": {
  166390. "hide_name": 0,
  166391. "bits": [ 161 ],
  166392. "attributes": {
  166393. }
  166394. },
  166395. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_1_SB_LUT4_O_I3": {
  166396. "hide_name": 0,
  166397. "bits": [ 201, 202, 121, 203 ],
  166398. "attributes": {
  166399. "force_downto": "00000000000000000000000000000001",
  166400. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166401. }
  166402. },
  166403. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_2": {
  166404. "hide_name": 0,
  166405. "bits": [ 151 ],
  166406. "attributes": {
  166407. }
  166408. },
  166409. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_3": {
  166410. "hide_name": 0,
  166411. "bits": [ 150 ],
  166412. "attributes": {
  166413. }
  166414. },
  166415. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_ADDRESS_4": {
  166416. "hide_name": 0,
  166417. "bits": [ 149 ],
  166418. "attributes": {
  166419. }
  166420. },
  166421. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_CHIPSELECT": {
  166422. "hide_name": 0,
  166423. "bits": [ 163 ],
  166424. "attributes": {
  166425. }
  166426. },
  166427. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN": {
  166428. "hide_name": 0,
  166429. "bits": [ 179 ],
  166430. "attributes": {
  166431. }
  166432. },
  166433. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_1": {
  166434. "hide_name": 0,
  166435. "bits": [ 178 ],
  166436. "attributes": {
  166437. }
  166438. },
  166439. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_10": {
  166440. "hide_name": 0,
  166441. "bits": [ 169 ],
  166442. "attributes": {
  166443. }
  166444. },
  166445. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_11": {
  166446. "hide_name": 0,
  166447. "bits": [ 168 ],
  166448. "attributes": {
  166449. }
  166450. },
  166451. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_12": {
  166452. "hide_name": 0,
  166453. "bits": [ 167 ],
  166454. "attributes": {
  166455. }
  166456. },
  166457. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_13": {
  166458. "hide_name": 0,
  166459. "bits": [ 166 ],
  166460. "attributes": {
  166461. }
  166462. },
  166463. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_14": {
  166464. "hide_name": 0,
  166465. "bits": [ 165 ],
  166466. "attributes": {
  166467. }
  166468. },
  166469. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_15": {
  166470. "hide_name": 0,
  166471. "bits": [ 164 ],
  166472. "attributes": {
  166473. }
  166474. },
  166475. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_2": {
  166476. "hide_name": 0,
  166477. "bits": [ 177 ],
  166478. "attributes": {
  166479. }
  166480. },
  166481. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_3": {
  166482. "hide_name": 0,
  166483. "bits": [ 176 ],
  166484. "attributes": {
  166485. }
  166486. },
  166487. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_4": {
  166488. "hide_name": 0,
  166489. "bits": [ 175 ],
  166490. "attributes": {
  166491. }
  166492. },
  166493. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_5": {
  166494. "hide_name": 0,
  166495. "bits": [ 174 ],
  166496. "attributes": {
  166497. }
  166498. },
  166499. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_6": {
  166500. "hide_name": 0,
  166501. "bits": [ 173 ],
  166502. "attributes": {
  166503. }
  166504. },
  166505. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_7": {
  166506. "hide_name": 0,
  166507. "bits": [ 172 ],
  166508. "attributes": {
  166509. }
  166510. },
  166511. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_8": {
  166512. "hide_name": 0,
  166513. "bits": [ 171 ],
  166514. "attributes": {
  166515. }
  166516. },
  166517. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_DATAIN_9": {
  166518. "hide_name": 0,
  166519. "bits": [ 170 ],
  166520. "attributes": {
  166521. }
  166522. },
  166523. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN": {
  166524. "hide_name": 0,
  166525. "bits": [ 199 ],
  166526. "attributes": {
  166527. }
  166528. },
  166529. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_1": {
  166530. "hide_name": 0,
  166531. "bits": [ 198 ],
  166532. "attributes": {
  166533. }
  166534. },
  166535. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_2": {
  166536. "hide_name": 0,
  166537. "bits": [ 197 ],
  166538. "attributes": {
  166539. }
  166540. },
  166541. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_MASKWREN_3": {
  166542. "hide_name": 0,
  166543. "bits": [ 196 ],
  166544. "attributes": {
  166545. }
  166546. },
  166547. "cache_I.data_ram_I.genblk1[0].genblk1[0].ram_I_WREN": {
  166548. "hide_name": 0,
  166549. "bits": [ 200 ],
  166550. "attributes": {
  166551. }
  166552. },
  166553. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN": {
  166554. "hide_name": 0,
  166555. "bits": [ 248 ],
  166556. "attributes": {
  166557. }
  166558. },
  166559. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_1": {
  166560. "hide_name": 0,
  166561. "bits": [ 247 ],
  166562. "attributes": {
  166563. }
  166564. },
  166565. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_10": {
  166566. "hide_name": 0,
  166567. "bits": [ 238 ],
  166568. "attributes": {
  166569. }
  166570. },
  166571. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_11": {
  166572. "hide_name": 0,
  166573. "bits": [ 237 ],
  166574. "attributes": {
  166575. }
  166576. },
  166577. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_12": {
  166578. "hide_name": 0,
  166579. "bits": [ 236 ],
  166580. "attributes": {
  166581. }
  166582. },
  166583. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_13": {
  166584. "hide_name": 0,
  166585. "bits": [ 235 ],
  166586. "attributes": {
  166587. }
  166588. },
  166589. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_14": {
  166590. "hide_name": 0,
  166591. "bits": [ 234 ],
  166592. "attributes": {
  166593. }
  166594. },
  166595. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_15": {
  166596. "hide_name": 0,
  166597. "bits": [ 233 ],
  166598. "attributes": {
  166599. }
  166600. },
  166601. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_2": {
  166602. "hide_name": 0,
  166603. "bits": [ 246 ],
  166604. "attributes": {
  166605. }
  166606. },
  166607. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_3": {
  166608. "hide_name": 0,
  166609. "bits": [ 245 ],
  166610. "attributes": {
  166611. }
  166612. },
  166613. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_4": {
  166614. "hide_name": 0,
  166615. "bits": [ 244 ],
  166616. "attributes": {
  166617. }
  166618. },
  166619. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_5": {
  166620. "hide_name": 0,
  166621. "bits": [ 243 ],
  166622. "attributes": {
  166623. }
  166624. },
  166625. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_6": {
  166626. "hide_name": 0,
  166627. "bits": [ 242 ],
  166628. "attributes": {
  166629. }
  166630. },
  166631. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_7": {
  166632. "hide_name": 0,
  166633. "bits": [ 241 ],
  166634. "attributes": {
  166635. }
  166636. },
  166637. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_8": {
  166638. "hide_name": 0,
  166639. "bits": [ 240 ],
  166640. "attributes": {
  166641. }
  166642. },
  166643. "cache_I.data_ram_I.genblk1[0].genblk1[1].ram_I_DATAIN_9": {
  166644. "hide_name": 0,
  166645. "bits": [ 239 ],
  166646. "attributes": {
  166647. }
  166648. },
  166649. "cache_I.data_ram_I.map.n": {
  166650. "hide_name": 0,
  166651. "bits": [ "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  166652. "signed": 1,
  166653. "attributes": {
  166654. "hdlname": "cache_I data_ram_I map.n",
  166655. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:83.11-83.12"
  166656. }
  166657. },
  166658. "cache_I.data_ram_I.map.o": {
  166659. "hide_name": 0,
  166660. "bits": [ "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  166661. "signed": 1,
  166662. "attributes": {
  166663. "hdlname": "cache_I data_ram_I map.o",
  166664. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:83.17-83.18"
  166665. }
  166666. },
  166667. "cache_I.data_ram_I.map.x": {
  166668. "hide_name": 0,
  166669. "bits": [ "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  166670. "signed": 1,
  166671. "attributes": {
  166672. "hdlname": "cache_I data_ram_I map.x",
  166673. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:83.14-83.15"
  166674. }
  166675. },
  166676. "cache_I.data_ram_I.mem_addr": {
  166677. "hide_name": 0,
  166678. "bits": [ 6889, 6890, 6891, 152, 153, 154, 155, 156, 157, 158, 159, 160, 6892, 6893 ],
  166679. "attributes": {
  166680. "hdlname": "cache_I data_ram_I mem_addr",
  166681. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:53.17-53.25",
  166682. "unused_bits": "0 1 2 12 13"
  166683. }
  166684. },
  166685. "cache_I.data_ram_I.mem_do[0]": {
  166686. "hide_name": 0,
  166687. "bits": [ 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191, 192, 193, 194, 195 ],
  166688. "attributes": {
  166689. "hdlname": "cache_I data_ram_I mem_do[0]",
  166690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:64.17-64.23"
  166691. }
  166692. },
  166693. "cache_I.data_ram_I.mem_do[1]": {
  166694. "hide_name": 0,
  166695. "bits": [ 249, 250, 251, 252, 253, 254, 255, 256, 257, 258, 259, 260, 261, 262, 263, 264 ],
  166696. "attributes": {
  166697. "hdlname": "cache_I data_ram_I mem_do[1]",
  166698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:64.17-64.23"
  166699. }
  166700. },
  166701. "cache_I.data_ram_I.mem_do_m[0]": {
  166702. "hide_name": 0,
  166703. "bits": [ 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191, 192, 193, 194, 195, 249, 250, 251, 252, 253, 254, 255, 256, 257, 258, 259, 260, 261, 262, 263, 264 ],
  166704. "attributes": {
  166705. "hdlname": "cache_I data_ram_I mem_do_m[0]",
  166706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:59.17-59.25"
  166707. }
  166708. },
  166709. "cache_I.data_ram_I.mem_do_w": {
  166710. "hide_name": 0,
  166711. "bits": [ 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191, 192, 193, 194, 195, 249, 250, 251, 252, 253, 254, 255, 256, 257, 258, 259, 260, 261, 262, 263, 264 ],
  166712. "attributes": {
  166713. "hdlname": "cache_I data_ram_I mem_do_w",
  166714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:60.17-60.25"
  166715. }
  166716. },
  166717. "cache_I.data_ram_I.mem_sel": {
  166718. "hide_name": 0,
  166719. "bits": [ "1" ],
  166720. "attributes": {
  166721. "hdlname": "cache_I data_ram_I mem_sel",
  166722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:55.17-55.24"
  166723. }
  166724. },
  166725. "cache_I.data_ram_I.rd_data": {
  166726. "hide_name": 0,
  166727. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  166728. "attributes": {
  166729. "hdlname": "cache_I data_ram_I rd_data",
  166730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:24.21-24.28"
  166731. }
  166732. },
  166733. "cache_I.data_ram_I.wr_mask": {
  166734. "hide_name": 0,
  166735. "bits": [ 6894, 6894, 6895, 6895, 6896, 6896, 6897, 6897 ],
  166736. "attributes": {
  166737. "hdlname": "cache_I data_ram_I wr_mask",
  166738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_spram_gen.v:27.21-27.28",
  166739. "unused_bits": "0 1 2 3 4 5 6 7"
  166740. }
  166741. },
  166742. "cache_I.dirty_next.w": {
  166743. "hide_name": 0,
  166744. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  166745. "signed": 1,
  166746. "attributes": {
  166747. "hdlname": "cache_I dirty_next.w",
  166748. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:366.11-366.12"
  166749. }
  166750. },
  166751. "cache_I.dm_addr": {
  166752. "hide_name": 0,
  166753. "bits": [ 6889, 6890, 6891, 152, 153, 154, 155, 156, 157, 158, 159, 160, 6892, 6893 ],
  166754. "attributes": {
  166755. "hdlname": "cache_I dm_addr",
  166756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:154.14-154.21",
  166757. "unused_bits": "0 1 2 12 13"
  166758. }
  166759. },
  166760. "cache_I.dm_rdata": {
  166761. "hide_name": 0,
  166762. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  166763. "attributes": {
  166764. "hdlname": "cache_I dm_rdata",
  166765. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:155.14-155.22"
  166766. }
  166767. },
  166768. "cache_I.dm_wmsk": {
  166769. "hide_name": 0,
  166770. "bits": [ 6894, 6895, 6896, 6897 ],
  166771. "attributes": {
  166772. "hdlname": "cache_I dm_wmsk",
  166773. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:159.14-159.21",
  166774. "unused_bits": "0 1 2 3"
  166775. }
  166776. },
  166777. "cache_I.dm_wmsk_nibble": {
  166778. "hide_name": 0,
  166779. "bits": [ 6894, 6894, 6895, 6895, 6896, 6896, 6897, 6897 ],
  166780. "attributes": {
  166781. "hdlname": "cache_I dm_wmsk_nibble",
  166782. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:158.14-158.28",
  166783. "unused_bits": "0 1 2 3 4 5 6 7"
  166784. }
  166785. },
  166786. "cache_I.ev_tag": {
  166787. "hide_name": 0,
  166788. "bits": [ 297, 284, 287, 309, 315, 322, 329, 336, 343, 350, 357, 290 ],
  166789. "attributes": {
  166790. "hdlname": "cache_I ev_tag",
  166791. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:147.14-147.20"
  166792. }
  166793. },
  166794. "cache_I.ev_tag_SB_LUT4_O_10_I2": {
  166795. "hide_name": 0,
  166796. "bits": [ 288, 289 ],
  166797. "attributes": {
  166798. "force_downto": "00000000000000000000000000000001",
  166799. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166800. }
  166801. },
  166802. "cache_I.ev_tag_SB_LUT4_O_11_I2": {
  166803. "hide_name": 0,
  166804. "bits": [ 295, 296 ],
  166805. "attributes": {
  166806. "force_downto": "00000000000000000000000000000001",
  166807. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166808. }
  166809. },
  166810. "cache_I.ev_tag_SB_LUT4_O_1_I2": {
  166811. "hide_name": 0,
  166812. "bits": [ 285, 286 ],
  166813. "attributes": {
  166814. "force_downto": "00000000000000000000000000000001",
  166815. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166816. }
  166817. },
  166818. "cache_I.ev_tag_SB_LUT4_O_2_I1": {
  166819. "hide_name": 0,
  166820. "bits": [ 306, 307, 148, 308 ],
  166821. "attributes": {
  166822. "force_downto": "00000000000000000000000000000001",
  166823. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166824. }
  166825. },
  166826. "cache_I.ev_tag_SB_LUT4_O_3_I2": {
  166827. "hide_name": 0,
  166828. "bits": [ 313, 314 ],
  166829. "attributes": {
  166830. "force_downto": "00000000000000000000000000000001",
  166831. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166832. }
  166833. },
  166834. "cache_I.ev_tag_SB_LUT4_O_4_I2": {
  166835. "hide_name": 0,
  166836. "bits": [ 320, 321 ],
  166837. "attributes": {
  166838. "force_downto": "00000000000000000000000000000001",
  166839. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166840. }
  166841. },
  166842. "cache_I.ev_tag_SB_LUT4_O_5_I2": {
  166843. "hide_name": 0,
  166844. "bits": [ 327, 328 ],
  166845. "attributes": {
  166846. "force_downto": "00000000000000000000000000000001",
  166847. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166848. }
  166849. },
  166850. "cache_I.ev_tag_SB_LUT4_O_6_I2": {
  166851. "hide_name": 0,
  166852. "bits": [ 334, 335 ],
  166853. "attributes": {
  166854. "force_downto": "00000000000000000000000000000001",
  166855. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166856. }
  166857. },
  166858. "cache_I.ev_tag_SB_LUT4_O_7_I2": {
  166859. "hide_name": 0,
  166860. "bits": [ 341, 342 ],
  166861. "attributes": {
  166862. "force_downto": "00000000000000000000000000000001",
  166863. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166864. }
  166865. },
  166866. "cache_I.ev_tag_SB_LUT4_O_8_I2": {
  166867. "hide_name": 0,
  166868. "bits": [ 348, 349 ],
  166869. "attributes": {
  166870. "force_downto": "00000000000000000000000000000001",
  166871. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166872. }
  166873. },
  166874. "cache_I.ev_tag_SB_LUT4_O_9_I2": {
  166875. "hide_name": 0,
  166876. "bits": [ 355, 356 ],
  166877. "attributes": {
  166878. "force_downto": "00000000000000000000000000000001",
  166879. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166880. }
  166881. },
  166882. "cache_I.ev_tag_r": {
  166883. "hide_name": 0,
  166884. "bits": [ 365, 364, 373, 372, 371, 370, 369, 368, 367, 366, 363, 362 ],
  166885. "attributes": {
  166886. "hdlname": "cache_I ev_tag_r",
  166887. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:151.14-151.22"
  166888. }
  166889. },
  166890. "cache_I.ev_valid": {
  166891. "hide_name": 0,
  166892. "bits": [ 377 ],
  166893. "attributes": {
  166894. "hdlname": "cache_I ev_valid",
  166895. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:145.14-145.22"
  166896. }
  166897. },
  166898. "cache_I.ev_valid_SB_LUT4_O_I1": {
  166899. "hide_name": 0,
  166900. "bits": [ 374, 375, 147, 376 ],
  166901. "attributes": {
  166902. "force_downto": "00000000000000000000000000000001",
  166903. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166904. }
  166905. },
  166906. "cache_I.ev_valid_r": {
  166907. "hide_name": 0,
  166908. "bits": [ 383 ],
  166909. "attributes": {
  166910. "hdlname": "cache_I ev_valid_r",
  166911. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:150.14-150.24"
  166912. }
  166913. },
  166914. "cache_I.ev_way": {
  166915. "hide_name": 0,
  166916. "bits": [ 393, 386 ],
  166917. "attributes": {
  166918. "hdlname": "cache_I ev_way",
  166919. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:144.14-144.20"
  166920. }
  166921. },
  166922. "cache_I.ev_way_SB_LUT4_I3_1_O": {
  166923. "hide_name": 0,
  166924. "bits": [ 281, 282, 148, 283 ],
  166925. "attributes": {
  166926. "force_downto": "00000000000000000000000000000001",
  166927. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166928. }
  166929. },
  166930. "cache_I.ev_way_SB_LUT4_I3_O": {
  166931. "hide_name": 0,
  166932. "bits": [ 387, 388, 147, 141 ],
  166933. "attributes": {
  166934. "force_downto": "00000000000000000000000000000001",
  166935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166936. }
  166937. },
  166938. "cache_I.ev_way_SB_LUT4_O_1_I2": {
  166939. "hide_name": 0,
  166940. "bits": [ 392, 147 ],
  166941. "attributes": {
  166942. "force_downto": "00000000000000000000000000000001",
  166943. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166944. }
  166945. },
  166946. "cache_I.ev_way_SB_LUT4_O_I3": {
  166947. "hide_name": 0,
  166948. "bits": [ 389, 144 ],
  166949. "attributes": {
  166950. "force_downto": "00000000000000000000000000000001",
  166951. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  166952. }
  166953. },
  166954. "cache_I.ev_way_r": {
  166955. "hide_name": 0,
  166956. "bits": [ 201, 209 ],
  166957. "attributes": {
  166958. "hdlname": "cache_I ev_way_r",
  166959. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:149.14-149.22"
  166960. }
  166961. },
  166962. "cache_I.evict.w": {
  166963. "hide_name": 0,
  166964. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  166965. "signed": 1,
  166966. "attributes": {
  166967. "hdlname": "cache_I evict.w",
  166968. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:332.11-332.12"
  166969. }
  166970. },
  166971. "cache_I.genblk1[0].tag_ram_I.clk": {
  166972. "hide_name": 0,
  166973. "bits": [ 42 ],
  166974. "attributes": {
  166975. "hdlname": "cache_I genblk1[0].tag_ram_I clk",
  166976. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:48.21-48.24"
  166977. }
  166978. },
  166979. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  166980. "hide_name": 0,
  166981. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  166982. "attributes": {
  166983. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  166984. "nosync": "00000000000000000000000000000001",
  166985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  166986. }
  166987. },
  166988. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  166989. "hide_name": 0,
  166990. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  166991. "attributes": {
  166992. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  166993. "nosync": "00000000000000000000000000000001",
  166994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  166995. }
  166996. },
  166997. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  166998. "hide_name": 0,
  166999. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167000. "attributes": {
  167001. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  167002. "nosync": "00000000000000000000000000000001",
  167003. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167004. }
  167005. },
  167006. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.genblk1.submask": {
  167007. "hide_name": 0,
  167008. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  167009. "attributes": {
  167010. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I genblk1.submask",
  167011. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  167012. "unused_bits": "8 9 10 11 12 13 14 15"
  167013. }
  167014. },
  167015. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.ram_rd_addr": {
  167016. "hide_name": 0,
  167017. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  167018. "attributes": {
  167019. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I ram_rd_addr",
  167020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  167021. }
  167022. },
  167023. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.ram_rd_data": {
  167024. "hide_name": 0,
  167025. "bits": [ 300, 401, 319, 402, 302, 403, 330, 404, 387, 405, 326, 406, 310, 407, 339, 408 ],
  167026. "attributes": {
  167027. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I ram_rd_data",
  167028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  167029. "unused_bits": "1 3 5 7 9 11 13 15"
  167030. }
  167031. },
  167032. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.ram_wr_addr": {
  167033. "hide_name": 0,
  167034. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  167035. "attributes": {
  167036. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I ram_wr_addr",
  167037. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  167038. }
  167039. },
  167040. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.ram_wr_data": {
  167041. "hide_name": 0,
  167042. "bits": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  167043. "attributes": {
  167044. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I ram_wr_data",
  167045. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  167046. }
  167047. },
  167048. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.ram_wr_mask": {
  167049. "hide_name": 0,
  167050. "bits": [ 6899, 6900, 6899, 6900, 6899, 6900, 6899, 6900, 6899, 6900, 6899, 6900, 6899, 6900, 6899, 6900 ],
  167051. "attributes": {
  167052. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I ram_wr_mask",
  167053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  167054. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15"
  167055. }
  167056. },
  167057. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.rd_addr": {
  167058. "hide_name": 0,
  167059. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167060. "attributes": {
  167061. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I rd_addr",
  167062. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  167063. }
  167064. },
  167065. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.rd_clk": {
  167066. "hide_name": 0,
  167067. "bits": [ 42 ],
  167068. "attributes": {
  167069. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I rd_clk",
  167070. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  167071. }
  167072. },
  167073. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.rd_data": {
  167074. "hide_name": 0,
  167075. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339 ],
  167076. "attributes": {
  167077. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I rd_data",
  167078. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  167079. }
  167080. },
  167081. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.rd_data_i": {
  167082. "hide_name": 0,
  167083. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339, 401, 405, 403, 407, 402, 406, 404, 408 ],
  167084. "attributes": {
  167085. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I rd_data_i",
  167086. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  167087. "unused_bits": "8 9 10 11 12 13 14 15"
  167088. }
  167089. },
  167090. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.rd_ena": {
  167091. "hide_name": 0,
  167092. "bits": [ 400 ],
  167093. "attributes": {
  167094. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I rd_ena",
  167095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  167096. }
  167097. },
  167098. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.wr_addr": {
  167099. "hide_name": 0,
  167100. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  167101. "attributes": {
  167102. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I wr_addr",
  167103. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  167104. }
  167105. },
  167106. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.wr_clk": {
  167107. "hide_name": 0,
  167108. "bits": [ 42 ],
  167109. "attributes": {
  167110. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I wr_clk",
  167111. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  167112. }
  167113. },
  167114. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.wr_data": {
  167115. "hide_name": 0,
  167116. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425 ],
  167117. "attributes": {
  167118. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I wr_data",
  167119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  167120. }
  167121. },
  167122. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.wr_ena": {
  167123. "hide_name": 0,
  167124. "bits": [ 417 ],
  167125. "attributes": {
  167126. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I wr_ena",
  167127. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  167128. }
  167129. },
  167130. "cache_I.genblk1[0].tag_ram_I.genblk1[0].ram_I.wr_mask": {
  167131. "hide_name": 0,
  167132. "bits": [ 473, 473, 473, 473, 473, 473, 473, 473 ],
  167133. "attributes": {
  167134. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[0].ram_I wr_mask",
  167135. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  167136. }
  167137. },
  167138. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  167139. "hide_name": 0,
  167140. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167141. "attributes": {
  167142. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  167143. "nosync": "00000000000000000000000000000001",
  167144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167145. }
  167146. },
  167147. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  167148. "hide_name": 0,
  167149. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167150. "attributes": {
  167151. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  167152. "nosync": "00000000000000000000000000000001",
  167153. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167154. }
  167155. },
  167156. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  167157. "hide_name": 0,
  167158. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167159. "attributes": {
  167160. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  167161. "nosync": "00000000000000000000000000000001",
  167162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167163. }
  167164. },
  167165. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.genblk1.submask": {
  167166. "hide_name": 0,
  167167. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  167168. "attributes": {
  167169. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I genblk1.submask",
  167170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  167171. "unused_bits": "8 9 10 11 12 13 14 15"
  167172. }
  167173. },
  167174. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I_MASK": {
  167175. "hide_name": 0,
  167176. "bits": [ 394, 395, 426, 427, 394, 395, 428, 429, 394, 395, 426, 427, 394, 395, 430, 431 ],
  167177. "attributes": {
  167178. "defaultvalue": "0000000000000000",
  167179. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  167180. }
  167181. },
  167182. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.ram_rd_addr": {
  167183. "hide_name": 0,
  167184. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  167185. "attributes": {
  167186. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I ram_rd_addr",
  167187. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  167188. }
  167189. },
  167190. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.ram_rd_data": {
  167191. "hide_name": 0,
  167192. "bits": [ 346, 432, 433, 434, 360, 435, 139, 436, 352, 437, 438, 439, 291, 440, 378, 441 ],
  167193. "attributes": {
  167194. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I ram_rd_data",
  167195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  167196. "unused_bits": "1 3 5 7 9 11 13 15"
  167197. }
  167198. },
  167199. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.ram_wr_addr": {
  167200. "hide_name": 0,
  167201. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  167202. "attributes": {
  167203. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I ram_wr_addr",
  167204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  167205. }
  167206. },
  167207. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.ram_wr_data": {
  167208. "hide_name": 0,
  167209. "bits": [ 442, 442, 443, 443, 444, 444, 445, 445, 446, 446, 447, 447, 448, 448, 449, 449 ],
  167210. "attributes": {
  167211. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I ram_wr_data",
  167212. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  167213. }
  167214. },
  167215. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.ram_wr_mask": {
  167216. "hide_name": 0,
  167217. "bits": [ 6899, 6900, 426, 6898, 6899, 6900, 6901, 6902, 6899, 6900, 426, 6898, 6899, 6900, 6903, 6904 ],
  167218. "attributes": {
  167219. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I ram_wr_mask",
  167220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  167221. "unused_bits": "0 1 3 4 5 6 7 8 9 11 12 13 14 15"
  167222. }
  167223. },
  167224. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.rd_addr": {
  167225. "hide_name": 0,
  167226. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167227. "attributes": {
  167228. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I rd_addr",
  167229. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  167230. }
  167231. },
  167232. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.rd_clk": {
  167233. "hide_name": 0,
  167234. "bits": [ 42 ],
  167235. "attributes": {
  167236. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I rd_clk",
  167237. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  167238. }
  167239. },
  167240. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.rd_data": {
  167241. "hide_name": 0,
  167242. "bits": [ 346, 352, 360, 291, 433, 438, 139, 378 ],
  167243. "attributes": {
  167244. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I rd_data",
  167245. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  167246. }
  167247. },
  167248. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.rd_data_i": {
  167249. "hide_name": 0,
  167250. "bits": [ 346, 352, 360, 291, 433, 438, 139, 378, 432, 437, 435, 440, 434, 439, 436, 441 ],
  167251. "attributes": {
  167252. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I rd_data_i",
  167253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  167254. "unused_bits": "8 9 10 11 12 13 14 15"
  167255. }
  167256. },
  167257. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.rd_ena": {
  167258. "hide_name": 0,
  167259. "bits": [ 400 ],
  167260. "attributes": {
  167261. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I rd_ena",
  167262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  167263. }
  167264. },
  167265. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.wr_addr": {
  167266. "hide_name": 0,
  167267. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  167268. "attributes": {
  167269. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I wr_addr",
  167270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  167271. }
  167272. },
  167273. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.wr_clk": {
  167274. "hide_name": 0,
  167275. "bits": [ 42 ],
  167276. "attributes": {
  167277. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I wr_clk",
  167278. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  167279. }
  167280. },
  167281. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.wr_data": {
  167282. "hide_name": 0,
  167283. "bits": [ 442, 446, 444, 448, 443, 447, 445, 449 ],
  167284. "attributes": {
  167285. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I wr_data",
  167286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  167287. }
  167288. },
  167289. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.wr_ena": {
  167290. "hide_name": 0,
  167291. "bits": [ 417 ],
  167292. "attributes": {
  167293. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I wr_ena",
  167294. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  167295. }
  167296. },
  167297. "cache_I.genblk1[0].tag_ram_I.genblk1[1].ram_I.wr_mask": {
  167298. "hide_name": 0,
  167299. "bits": [ 473, 473, 473, 473, "0", "0", 472, 471 ],
  167300. "attributes": {
  167301. "hdlname": "cache_I genblk1[0].tag_ram_I genblk1[1].ram_I wr_mask",
  167302. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  167303. }
  167304. },
  167305. "cache_I.genblk1[0].tag_ram_I.r_addr": {
  167306. "hide_name": 0,
  167307. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167308. "attributes": {
  167309. "hdlname": "cache_I genblk1[0].tag_ram_I r_addr",
  167310. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:80.24-80.30"
  167311. }
  167312. },
  167313. "cache_I.genblk1[0].tag_ram_I.r_age": {
  167314. "hide_name": 0,
  167315. "bits": [ 433, 438 ],
  167316. "attributes": {
  167317. "hdlname": "cache_I genblk1[0].tag_ram_I r_age",
  167318. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:44.21-44.26"
  167319. }
  167320. },
  167321. "cache_I.genblk1[0].tag_ram_I.r_dirty": {
  167322. "hide_name": 0,
  167323. "bits": [ 139 ],
  167324. "attributes": {
  167325. "hdlname": "cache_I genblk1[0].tag_ram_I r_dirty",
  167326. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:43.21-43.28"
  167327. }
  167328. },
  167329. "cache_I.genblk1[0].tag_ram_I.r_ena": {
  167330. "hide_name": 0,
  167331. "bits": [ 400 ],
  167332. "attributes": {
  167333. "hdlname": "cache_I genblk1[0].tag_ram_I r_ena",
  167334. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:40.21-40.26"
  167335. }
  167336. },
  167337. "cache_I.genblk1[0].tag_ram_I.r_idx": {
  167338. "hide_name": 0,
  167339. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167340. "attributes": {
  167341. "hdlname": "cache_I genblk1[0].tag_ram_I r_idx",
  167342. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:39.21-39.26"
  167343. }
  167344. },
  167345. "cache_I.genblk1[0].tag_ram_I.r_tag": {
  167346. "hide_name": 0,
  167347. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339, 346, 352, 360, 291 ],
  167348. "attributes": {
  167349. "hdlname": "cache_I genblk1[0].tag_ram_I r_tag",
  167350. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:45.21-45.26"
  167351. }
  167352. },
  167353. "cache_I.genblk1[0].tag_ram_I.r_val": {
  167354. "hide_name": 0,
  167355. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339, 346, 352, 360, 291, 433, 438, 139, 378 ],
  167356. "attributes": {
  167357. "hdlname": "cache_I genblk1[0].tag_ram_I r_val",
  167358. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:82.24-82.29"
  167359. }
  167360. },
  167361. "cache_I.genblk1[0].tag_ram_I.r_valid": {
  167362. "hide_name": 0,
  167363. "bits": [ 378 ],
  167364. "attributes": {
  167365. "hdlname": "cache_I genblk1[0].tag_ram_I r_valid",
  167366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:42.21-42.28"
  167367. }
  167368. },
  167369. "cache_I.genblk1[0].tag_ram_I.w_addr": {
  167370. "hide_name": 0,
  167371. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  167372. "attributes": {
  167373. "hdlname": "cache_I genblk1[0].tag_ram_I w_addr",
  167374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:78.24-78.30"
  167375. }
  167376. },
  167377. "cache_I.genblk1[0].tag_ram_I.w_addr_r": {
  167378. "hide_name": 0,
  167379. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  167380. "attributes": {
  167381. "hdlname": "cache_I genblk1[0].tag_ram_I w_addr_r",
  167382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:79.24-79.32"
  167383. }
  167384. },
  167385. "cache_I.genblk1[0].tag_ram_I.w_age": {
  167386. "hide_name": 0,
  167387. "bits": [ 455, 452 ],
  167388. "attributes": {
  167389. "hdlname": "cache_I genblk1[0].tag_ram_I w_age",
  167390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:33.21-33.26"
  167391. }
  167392. },
  167393. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1_I2": {
  167394. "hide_name": 0,
  167395. "bits": [ 378, 121, 453, 454 ],
  167396. "attributes": {
  167397. "force_downto": "00000000000000000000000000000001",
  167398. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167399. }
  167400. },
  167401. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2": {
  167402. "hide_name": 0,
  167403. "bits": [ 433, 457, 458, 459 ],
  167404. "attributes": {
  167405. "force_downto": "00000000000000000000000000000001",
  167406. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167407. }
  167408. },
  167409. "cache_I.genblk1[0].tag_ram_I.w_age_SB_LUT4_O_I2": {
  167410. "hide_name": 0,
  167411. "bits": [ 378, 125, 450, 451 ],
  167412. "attributes": {
  167413. "force_downto": "00000000000000000000000000000001",
  167414. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167415. }
  167416. },
  167417. "cache_I.genblk1[0].tag_ram_I.w_age_we": {
  167418. "hide_name": 0,
  167419. "bits": [ "1" ],
  167420. "attributes": {
  167421. "hdlname": "cache_I genblk1[0].tag_ram_I w_age_we",
  167422. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:32.21-32.29"
  167423. }
  167424. },
  167425. "cache_I.genblk1[0].tag_ram_I.w_dirty": {
  167426. "hide_name": 0,
  167427. "bits": [ 125 ],
  167428. "attributes": {
  167429. "hdlname": "cache_I genblk1[0].tag_ram_I w_dirty",
  167430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:30.21-30.28"
  167431. }
  167432. },
  167433. "cache_I.genblk1[0].tag_ram_I.w_ena": {
  167434. "hide_name": 0,
  167435. "bits": [ 465 ],
  167436. "attributes": {
  167437. "hdlname": "cache_I genblk1[0].tag_ram_I w_ena",
  167438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:24.21-24.26"
  167439. }
  167440. },
  167441. "cache_I.genblk1[0].tag_ram_I.w_ena_r": {
  167442. "hide_name": 0,
  167443. "bits": [ 417 ],
  167444. "attributes": {
  167445. "hdlname": "cache_I genblk1[0].tag_ram_I w_ena_r",
  167446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:88.7-88.14"
  167447. }
  167448. },
  167449. "cache_I.genblk1[0].tag_ram_I.w_idx": {
  167450. "hide_name": 0,
  167451. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  167452. "attributes": {
  167453. "hdlname": "cache_I genblk1[0].tag_ram_I w_idx",
  167454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:23.21-23.26"
  167455. }
  167456. },
  167457. "cache_I.genblk1[0].tag_ram_I.w_msk": {
  167458. "hide_name": 0,
  167459. "bits": [ 466, 466, 466, 466, 466, 466, 466, 466, 466, 466, 466, 466, "0", "0", 468, 467 ],
  167460. "attributes": {
  167461. "hdlname": "cache_I genblk1[0].tag_ram_I w_msk",
  167462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:85.24-85.29"
  167463. }
  167464. },
  167465. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O_2_I3": {
  167466. "hide_name": 0,
  167467. "bits": [ 205, 557, 121, 231 ],
  167468. "attributes": {
  167469. "force_downto": "00000000000000000000000000000001",
  167470. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167471. }
  167472. },
  167473. "cache_I.genblk1[0].tag_ram_I.w_msk_SB_LUT4_O_I3": {
  167474. "hide_name": 0,
  167475. "bits": [ 123, 124, 456 ],
  167476. "attributes": {
  167477. "force_downto": "00000000000000000000000000000001",
  167478. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167479. }
  167480. },
  167481. "cache_I.genblk1[0].tag_ram_I.w_msk_r": {
  167482. "hide_name": 0,
  167483. "bits": [ 473, 473, 473, 473, 473, 473, 473, 473, 473, 473, 473, 473, "0", "0", 472, 471 ],
  167484. "attributes": {
  167485. "hdlname": "cache_I genblk1[0].tag_ram_I w_msk_r",
  167486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:86.24-86.31"
  167487. }
  167488. },
  167489. "cache_I.genblk1[0].tag_ram_I.w_msk_r_SB_LUT4_I3_O": {
  167490. "hide_name": 0,
  167491. "bits": [ 394, 395, 394, 395, 394, 395, 394, 395, 394, 395, 394, 395, 394, 395, 394, 395 ],
  167492. "attributes": {
  167493. "defaultvalue": "0000000000000000",
  167494. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  167495. }
  167496. },
  167497. "cache_I.genblk1[0].tag_ram_I.w_tag": {
  167498. "hide_name": 0,
  167499. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  167500. "attributes": {
  167501. "hdlname": "cache_I genblk1[0].tag_ram_I w_tag",
  167502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:36.21-36.26"
  167503. }
  167504. },
  167505. "cache_I.genblk1[0].tag_ram_I.w_val": {
  167506. "hide_name": 0,
  167507. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480, 455, 452, 125, 121 ],
  167508. "attributes": {
  167509. "hdlname": "cache_I genblk1[0].tag_ram_I w_val",
  167510. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:83.24-83.29"
  167511. }
  167512. },
  167513. "cache_I.genblk1[0].tag_ram_I.w_val_r": {
  167514. "hide_name": 0,
  167515. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425, 442, 446, 444, 448, 443, 447, 445, 449 ],
  167516. "attributes": {
  167517. "hdlname": "cache_I genblk1[0].tag_ram_I w_val_r",
  167518. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:84.24-84.31"
  167519. }
  167520. },
  167521. "cache_I.genblk1[0].tag_ram_I.w_valid": {
  167522. "hide_name": 0,
  167523. "bits": [ 121 ],
  167524. "attributes": {
  167525. "hdlname": "cache_I genblk1[0].tag_ram_I w_valid",
  167526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:27.21-27.28"
  167527. }
  167528. },
  167529. "cache_I.genblk1[1].tag_ram_I.clk": {
  167530. "hide_name": 0,
  167531. "bits": [ 42 ],
  167532. "attributes": {
  167533. "hdlname": "cache_I genblk1[1].tag_ram_I clk",
  167534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:48.21-48.24"
  167535. }
  167536. },
  167537. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  167538. "hide_name": 0,
  167539. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167540. "attributes": {
  167541. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  167542. "nosync": "00000000000000000000000000000001",
  167543. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167544. }
  167545. },
  167546. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  167547. "hide_name": 0,
  167548. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167549. "attributes": {
  167550. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  167551. "nosync": "00000000000000000000000000000001",
  167552. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167553. }
  167554. },
  167555. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  167556. "hide_name": 0,
  167557. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167558. "attributes": {
  167559. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  167560. "nosync": "00000000000000000000000000000001",
  167561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167562. }
  167563. },
  167564. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.genblk1.submask": {
  167565. "hide_name": 0,
  167566. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  167567. "attributes": {
  167568. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I genblk1.submask",
  167569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  167570. "unused_bits": "8 9 10 11 12 13 14 15"
  167571. }
  167572. },
  167573. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.ram_rd_addr": {
  167574. "hide_name": 0,
  167575. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  167576. "attributes": {
  167577. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I ram_rd_addr",
  167578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  167579. }
  167580. },
  167581. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.ram_rd_data": {
  167582. "hide_name": 0,
  167583. "bits": [ 298, 488, 317, 489, 304, 490, 333, 491, 281, 492, 324, 493, 306, 494, 338, 495 ],
  167584. "attributes": {
  167585. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I ram_rd_data",
  167586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  167587. "unused_bits": "1 3 5 7 9 11 13 15"
  167588. }
  167589. },
  167590. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.ram_wr_addr": {
  167591. "hide_name": 0,
  167592. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  167593. "attributes": {
  167594. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I ram_wr_addr",
  167595. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  167596. }
  167597. },
  167598. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.ram_wr_data": {
  167599. "hide_name": 0,
  167600. "bits": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  167601. "attributes": {
  167602. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I ram_wr_data",
  167603. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  167604. }
  167605. },
  167606. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.ram_wr_mask": {
  167607. "hide_name": 0,
  167608. "bits": [ 6905, 6906, 6905, 6906, 6905, 6906, 6905, 6906, 6905, 6906, 6905, 6906, 6905, 6906, 6905, 6906 ],
  167609. "attributes": {
  167610. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I ram_wr_mask",
  167611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  167612. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15"
  167613. }
  167614. },
  167615. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.rd_addr": {
  167616. "hide_name": 0,
  167617. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167618. "attributes": {
  167619. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I rd_addr",
  167620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  167621. }
  167622. },
  167623. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.rd_clk": {
  167624. "hide_name": 0,
  167625. "bits": [ 42 ],
  167626. "attributes": {
  167627. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I rd_clk",
  167628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  167629. }
  167630. },
  167631. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.rd_data": {
  167632. "hide_name": 0,
  167633. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338 ],
  167634. "attributes": {
  167635. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I rd_data",
  167636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  167637. }
  167638. },
  167639. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.rd_data_i": {
  167640. "hide_name": 0,
  167641. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338, 488, 492, 490, 494, 489, 493, 491, 495 ],
  167642. "attributes": {
  167643. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I rd_data_i",
  167644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  167645. "unused_bits": "8 9 10 11 12 13 14 15"
  167646. }
  167647. },
  167648. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.rd_ena": {
  167649. "hide_name": 0,
  167650. "bits": [ 400 ],
  167651. "attributes": {
  167652. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I rd_ena",
  167653. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  167654. }
  167655. },
  167656. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.wr_addr": {
  167657. "hide_name": 0,
  167658. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  167659. "attributes": {
  167660. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I wr_addr",
  167661. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  167662. }
  167663. },
  167664. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.wr_clk": {
  167665. "hide_name": 0,
  167666. "bits": [ 42 ],
  167667. "attributes": {
  167668. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I wr_clk",
  167669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  167670. }
  167671. },
  167672. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.wr_data": {
  167673. "hide_name": 0,
  167674. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425 ],
  167675. "attributes": {
  167676. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I wr_data",
  167677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  167678. }
  167679. },
  167680. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.wr_ena": {
  167681. "hide_name": 0,
  167682. "bits": [ 417 ],
  167683. "attributes": {
  167684. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I wr_ena",
  167685. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  167686. }
  167687. },
  167688. "cache_I.genblk1[1].tag_ram_I.genblk1[0].ram_I.wr_mask": {
  167689. "hide_name": 0,
  167690. "bits": [ 524, 524, 524, 524, 524, 524, 524, 524 ],
  167691. "attributes": {
  167692. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[0].ram_I wr_mask",
  167693. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  167694. }
  167695. },
  167696. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  167697. "hide_name": 0,
  167698. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167699. "attributes": {
  167700. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  167701. "nosync": "00000000000000000000000000000001",
  167702. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167703. }
  167704. },
  167705. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  167706. "hide_name": 0,
  167707. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167708. "attributes": {
  167709. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  167710. "nosync": "00000000000000000000000000000001",
  167711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167712. }
  167713. },
  167714. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  167715. "hide_name": 0,
  167716. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  167717. "attributes": {
  167718. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  167719. "nosync": "00000000000000000000000000000001",
  167720. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  167721. }
  167722. },
  167723. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.genblk1.submask": {
  167724. "hide_name": 0,
  167725. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  167726. "attributes": {
  167727. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I genblk1.submask",
  167728. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  167729. "unused_bits": "8 9 10 11 12 13 14 15"
  167730. }
  167731. },
  167732. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I_MASK": {
  167733. "hide_name": 0,
  167734. "bits": [ 486, 487, 426, 427, 486, 487, 496, 497, 486, 487, 426, 427, 486, 487, 498, 499 ],
  167735. "attributes": {
  167736. "defaultvalue": "0000000000000000",
  167737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  167738. }
  167739. },
  167740. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.ram_rd_addr": {
  167741. "hide_name": 0,
  167742. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  167743. "attributes": {
  167744. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I ram_rd_addr",
  167745. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  167746. }
  167747. },
  167748. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.ram_rd_data": {
  167749. "hide_name": 0,
  167750. "bits": [ 345, 500, 385, 501, 359, 502, 145, 503, 353, 504, 384, 505, 293, 506, 379, 507 ],
  167751. "attributes": {
  167752. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I ram_rd_data",
  167753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  167754. "unused_bits": "1 3 5 7 9 11 13 15"
  167755. }
  167756. },
  167757. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.ram_wr_addr": {
  167758. "hide_name": 0,
  167759. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  167760. "attributes": {
  167761. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I ram_wr_addr",
  167762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  167763. }
  167764. },
  167765. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.ram_wr_data": {
  167766. "hide_name": 0,
  167767. "bits": [ 442, 442, 508, 508, 444, 444, 445, 445, 446, 446, 509, 509, 448, 448, 449, 449 ],
  167768. "attributes": {
  167769. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I ram_wr_data",
  167770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  167771. }
  167772. },
  167773. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.ram_wr_mask": {
  167774. "hide_name": 0,
  167775. "bits": [ 6905, 6906, 426, 6898, 6905, 6906, 6907, 6908, 6905, 6906, 426, 6898, 6905, 6906, 6909, 6910 ],
  167776. "attributes": {
  167777. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I ram_wr_mask",
  167778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  167779. "unused_bits": "0 1 3 4 5 6 7 8 9 11 12 13 14 15"
  167780. }
  167781. },
  167782. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.rd_addr": {
  167783. "hide_name": 0,
  167784. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167785. "attributes": {
  167786. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I rd_addr",
  167787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  167788. }
  167789. },
  167790. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.rd_clk": {
  167791. "hide_name": 0,
  167792. "bits": [ 42 ],
  167793. "attributes": {
  167794. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I rd_clk",
  167795. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  167796. }
  167797. },
  167798. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.rd_data": {
  167799. "hide_name": 0,
  167800. "bits": [ 345, 353, 359, 293, 385, 384, 145, 379 ],
  167801. "attributes": {
  167802. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I rd_data",
  167803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  167804. }
  167805. },
  167806. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.rd_data_i": {
  167807. "hide_name": 0,
  167808. "bits": [ 345, 353, 359, 293, 385, 384, 145, 379, 500, 504, 502, 506, 501, 505, 503, 507 ],
  167809. "attributes": {
  167810. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I rd_data_i",
  167811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  167812. "unused_bits": "8 9 10 11 12 13 14 15"
  167813. }
  167814. },
  167815. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.rd_ena": {
  167816. "hide_name": 0,
  167817. "bits": [ 400 ],
  167818. "attributes": {
  167819. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I rd_ena",
  167820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  167821. }
  167822. },
  167823. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.wr_addr": {
  167824. "hide_name": 0,
  167825. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  167826. "attributes": {
  167827. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I wr_addr",
  167828. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  167829. }
  167830. },
  167831. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.wr_clk": {
  167832. "hide_name": 0,
  167833. "bits": [ 42 ],
  167834. "attributes": {
  167835. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I wr_clk",
  167836. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  167837. }
  167838. },
  167839. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.wr_data": {
  167840. "hide_name": 0,
  167841. "bits": [ 442, 446, 444, 448, 508, 509, 445, 449 ],
  167842. "attributes": {
  167843. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I wr_data",
  167844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  167845. }
  167846. },
  167847. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.wr_ena": {
  167848. "hide_name": 0,
  167849. "bits": [ 417 ],
  167850. "attributes": {
  167851. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I wr_ena",
  167852. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  167853. }
  167854. },
  167855. "cache_I.genblk1[1].tag_ram_I.genblk1[1].ram_I.wr_mask": {
  167856. "hide_name": 0,
  167857. "bits": [ 524, 524, 524, 524, "0", "0", 523, 522 ],
  167858. "attributes": {
  167859. "hdlname": "cache_I genblk1[1].tag_ram_I genblk1[1].ram_I wr_mask",
  167860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  167861. }
  167862. },
  167863. "cache_I.genblk1[1].tag_ram_I.r_addr": {
  167864. "hide_name": 0,
  167865. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167866. "attributes": {
  167867. "hdlname": "cache_I genblk1[1].tag_ram_I r_addr",
  167868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:80.24-80.30"
  167869. }
  167870. },
  167871. "cache_I.genblk1[1].tag_ram_I.r_age": {
  167872. "hide_name": 0,
  167873. "bits": [ 385, 384 ],
  167874. "attributes": {
  167875. "hdlname": "cache_I genblk1[1].tag_ram_I r_age",
  167876. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:44.21-44.26"
  167877. }
  167878. },
  167879. "cache_I.genblk1[1].tag_ram_I.r_dirty": {
  167880. "hide_name": 0,
  167881. "bits": [ 145 ],
  167882. "attributes": {
  167883. "hdlname": "cache_I genblk1[1].tag_ram_I r_dirty",
  167884. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:43.21-43.28"
  167885. }
  167886. },
  167887. "cache_I.genblk1[1].tag_ram_I.r_ena": {
  167888. "hide_name": 0,
  167889. "bits": [ 400 ],
  167890. "attributes": {
  167891. "hdlname": "cache_I genblk1[1].tag_ram_I r_ena",
  167892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:40.21-40.26"
  167893. }
  167894. },
  167895. "cache_I.genblk1[1].tag_ram_I.r_idx": {
  167896. "hide_name": 0,
  167897. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  167898. "attributes": {
  167899. "hdlname": "cache_I genblk1[1].tag_ram_I r_idx",
  167900. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:39.21-39.26"
  167901. }
  167902. },
  167903. "cache_I.genblk1[1].tag_ram_I.r_tag": {
  167904. "hide_name": 0,
  167905. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338, 345, 353, 359, 293 ],
  167906. "attributes": {
  167907. "hdlname": "cache_I genblk1[1].tag_ram_I r_tag",
  167908. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:45.21-45.26"
  167909. }
  167910. },
  167911. "cache_I.genblk1[1].tag_ram_I.r_val": {
  167912. "hide_name": 0,
  167913. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338, 345, 353, 359, 293, 385, 384, 145, 379 ],
  167914. "attributes": {
  167915. "hdlname": "cache_I genblk1[1].tag_ram_I r_val",
  167916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:82.24-82.29"
  167917. }
  167918. },
  167919. "cache_I.genblk1[1].tag_ram_I.r_valid": {
  167920. "hide_name": 0,
  167921. "bits": [ 379 ],
  167922. "attributes": {
  167923. "hdlname": "cache_I genblk1[1].tag_ram_I r_valid",
  167924. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:42.21-42.28"
  167925. }
  167926. },
  167927. "cache_I.genblk1[1].tag_ram_I.w_addr": {
  167928. "hide_name": 0,
  167929. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  167930. "attributes": {
  167931. "hdlname": "cache_I genblk1[1].tag_ram_I w_addr",
  167932. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:78.24-78.30"
  167933. }
  167934. },
  167935. "cache_I.genblk1[1].tag_ram_I.w_addr_r": {
  167936. "hide_name": 0,
  167937. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  167938. "attributes": {
  167939. "hdlname": "cache_I genblk1[1].tag_ram_I w_addr_r",
  167940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:79.24-79.32"
  167941. }
  167942. },
  167943. "cache_I.genblk1[1].tag_ram_I.w_age": {
  167944. "hide_name": 0,
  167945. "bits": [ 515, 512 ],
  167946. "attributes": {
  167947. "hdlname": "cache_I genblk1[1].tag_ram_I w_age",
  167948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:33.21-33.26"
  167949. }
  167950. },
  167951. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_1_I2": {
  167952. "hide_name": 0,
  167953. "bits": [ 379, 121, 513, 514 ],
  167954. "attributes": {
  167955. "force_downto": "00000000000000000000000000000001",
  167956. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167957. }
  167958. },
  167959. "cache_I.genblk1[1].tag_ram_I.w_age_SB_LUT4_O_I2": {
  167960. "hide_name": 0,
  167961. "bits": [ 379, 125, 510, 511 ],
  167962. "attributes": {
  167963. "force_downto": "00000000000000000000000000000001",
  167964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  167965. }
  167966. },
  167967. "cache_I.genblk1[1].tag_ram_I.w_age_we": {
  167968. "hide_name": 0,
  167969. "bits": [ "1" ],
  167970. "attributes": {
  167971. "hdlname": "cache_I genblk1[1].tag_ram_I w_age_we",
  167972. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:32.21-32.29"
  167973. }
  167974. },
  167975. "cache_I.genblk1[1].tag_ram_I.w_dirty": {
  167976. "hide_name": 0,
  167977. "bits": [ 125 ],
  167978. "attributes": {
  167979. "hdlname": "cache_I genblk1[1].tag_ram_I w_dirty",
  167980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:30.21-30.28"
  167981. }
  167982. },
  167983. "cache_I.genblk1[1].tag_ram_I.w_ena": {
  167984. "hide_name": 0,
  167985. "bits": [ 465 ],
  167986. "attributes": {
  167987. "hdlname": "cache_I genblk1[1].tag_ram_I w_ena",
  167988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:24.21-24.26"
  167989. }
  167990. },
  167991. "cache_I.genblk1[1].tag_ram_I.w_ena_r": {
  167992. "hide_name": 0,
  167993. "bits": [ 417 ],
  167994. "attributes": {
  167995. "hdlname": "cache_I genblk1[1].tag_ram_I w_ena_r",
  167996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:88.7-88.14"
  167997. }
  167998. },
  167999. "cache_I.genblk1[1].tag_ram_I.w_idx": {
  168000. "hide_name": 0,
  168001. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  168002. "attributes": {
  168003. "hdlname": "cache_I genblk1[1].tag_ram_I w_idx",
  168004. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:23.21-23.26"
  168005. }
  168006. },
  168007. "cache_I.genblk1[1].tag_ram_I.w_msk": {
  168008. "hide_name": 0,
  168009. "bits": [ 519, 519, 519, 519, 519, 519, 519, 519, 519, 519, 519, 519, "0", "0", 521, 520 ],
  168010. "attributes": {
  168011. "hdlname": "cache_I genblk1[1].tag_ram_I w_msk",
  168012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:85.24-85.29"
  168013. }
  168014. },
  168015. "cache_I.genblk1[1].tag_ram_I.w_msk_SB_LUT4_O_I3": {
  168016. "hide_name": 0,
  168017. "bits": [ 384, 385, 383, 516 ],
  168018. "attributes": {
  168019. "force_downto": "00000000000000000000000000000001",
  168020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168021. }
  168022. },
  168023. "cache_I.genblk1[1].tag_ram_I.w_msk_r": {
  168024. "hide_name": 0,
  168025. "bits": [ 524, 524, 524, 524, 524, 524, 524, 524, 524, 524, 524, 524, "0", "0", 523, 522 ],
  168026. "attributes": {
  168027. "hdlname": "cache_I genblk1[1].tag_ram_I w_msk_r",
  168028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:86.24-86.31"
  168029. }
  168030. },
  168031. "cache_I.genblk1[1].tag_ram_I.w_msk_r_SB_LUT4_I3_O": {
  168032. "hide_name": 0,
  168033. "bits": [ 486, 487, 486, 487, 486, 487, 486, 487, 486, 487, 486, 487, 486, 487, 486, 487 ],
  168034. "attributes": {
  168035. "defaultvalue": "0000000000000000",
  168036. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  168037. }
  168038. },
  168039. "cache_I.genblk1[1].tag_ram_I.w_tag": {
  168040. "hide_name": 0,
  168041. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  168042. "attributes": {
  168043. "hdlname": "cache_I genblk1[1].tag_ram_I w_tag",
  168044. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:36.21-36.26"
  168045. }
  168046. },
  168047. "cache_I.genblk1[1].tag_ram_I.w_val": {
  168048. "hide_name": 0,
  168049. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480, 515, 512, 125, 121 ],
  168050. "attributes": {
  168051. "hdlname": "cache_I genblk1[1].tag_ram_I w_val",
  168052. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:83.24-83.29"
  168053. }
  168054. },
  168055. "cache_I.genblk1[1].tag_ram_I.w_val_r": {
  168056. "hide_name": 0,
  168057. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425, 442, 446, 444, 448, 508, 509, 445, 449 ],
  168058. "attributes": {
  168059. "hdlname": "cache_I genblk1[1].tag_ram_I w_val_r",
  168060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:84.24-84.31"
  168061. }
  168062. },
  168063. "cache_I.genblk1[1].tag_ram_I.w_valid": {
  168064. "hide_name": 0,
  168065. "bits": [ 121 ],
  168066. "attributes": {
  168067. "hdlname": "cache_I genblk1[1].tag_ram_I w_valid",
  168068. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:27.21-27.28"
  168069. }
  168070. },
  168071. "cache_I.genblk1[2].tag_ram_I.clk": {
  168072. "hide_name": 0,
  168073. "bits": [ 42 ],
  168074. "attributes": {
  168075. "hdlname": "cache_I genblk1[2].tag_ram_I clk",
  168076. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:48.21-48.24"
  168077. }
  168078. },
  168079. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  168080. "hide_name": 0,
  168081. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168082. "attributes": {
  168083. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  168084. "nosync": "00000000000000000000000000000001",
  168085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168086. }
  168087. },
  168088. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  168089. "hide_name": 0,
  168090. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168091. "attributes": {
  168092. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  168093. "nosync": "00000000000000000000000000000001",
  168094. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168095. }
  168096. },
  168097. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  168098. "hide_name": 0,
  168099. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168100. "attributes": {
  168101. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  168102. "nosync": "00000000000000000000000000000001",
  168103. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168104. }
  168105. },
  168106. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.genblk1.submask": {
  168107. "hide_name": 0,
  168108. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  168109. "attributes": {
  168110. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I genblk1.submask",
  168111. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  168112. "unused_bits": "8 9 10 11 12 13 14 15"
  168113. }
  168114. },
  168115. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.ram_rd_addr": {
  168116. "hide_name": 0,
  168117. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  168118. "attributes": {
  168119. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I ram_rd_addr",
  168120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  168121. }
  168122. },
  168123. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.ram_rd_data": {
  168124. "hide_name": 0,
  168125. "bits": [ 299, 527, 316, 528, 305, 529, 332, 530, 388, 531, 325, 532, 311, 533, 337, 534 ],
  168126. "attributes": {
  168127. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I ram_rd_data",
  168128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  168129. "unused_bits": "1 3 5 7 9 11 13 15"
  168130. }
  168131. },
  168132. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.ram_wr_addr": {
  168133. "hide_name": 0,
  168134. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  168135. "attributes": {
  168136. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I ram_wr_addr",
  168137. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  168138. }
  168139. },
  168140. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.ram_wr_data": {
  168141. "hide_name": 0,
  168142. "bits": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  168143. "attributes": {
  168144. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I ram_wr_data",
  168145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  168146. }
  168147. },
  168148. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.ram_wr_mask": {
  168149. "hide_name": 0,
  168150. "bits": [ 6911, 6912, 6911, 6912, 6911, 6912, 6911, 6912, 6911, 6912, 6911, 6912, 6911, 6912, 6911, 6912 ],
  168151. "attributes": {
  168152. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I ram_wr_mask",
  168153. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  168154. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15"
  168155. }
  168156. },
  168157. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.rd_addr": {
  168158. "hide_name": 0,
  168159. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168160. "attributes": {
  168161. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I rd_addr",
  168162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  168163. }
  168164. },
  168165. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.rd_clk": {
  168166. "hide_name": 0,
  168167. "bits": [ 42 ],
  168168. "attributes": {
  168169. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I rd_clk",
  168170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  168171. }
  168172. },
  168173. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.rd_data": {
  168174. "hide_name": 0,
  168175. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337 ],
  168176. "attributes": {
  168177. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I rd_data",
  168178. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  168179. }
  168180. },
  168181. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.rd_data_i": {
  168182. "hide_name": 0,
  168183. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337, 527, 531, 529, 533, 528, 532, 530, 534 ],
  168184. "attributes": {
  168185. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I rd_data_i",
  168186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  168187. "unused_bits": "8 9 10 11 12 13 14 15"
  168188. }
  168189. },
  168190. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.rd_ena": {
  168191. "hide_name": 0,
  168192. "bits": [ 400 ],
  168193. "attributes": {
  168194. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I rd_ena",
  168195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  168196. }
  168197. },
  168198. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.wr_addr": {
  168199. "hide_name": 0,
  168200. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  168201. "attributes": {
  168202. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I wr_addr",
  168203. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  168204. }
  168205. },
  168206. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.wr_clk": {
  168207. "hide_name": 0,
  168208. "bits": [ 42 ],
  168209. "attributes": {
  168210. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I wr_clk",
  168211. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  168212. }
  168213. },
  168214. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.wr_data": {
  168215. "hide_name": 0,
  168216. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425 ],
  168217. "attributes": {
  168218. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I wr_data",
  168219. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  168220. }
  168221. },
  168222. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.wr_ena": {
  168223. "hide_name": 0,
  168224. "bits": [ 417 ],
  168225. "attributes": {
  168226. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I wr_ena",
  168227. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  168228. }
  168229. },
  168230. "cache_I.genblk1[2].tag_ram_I.genblk1[0].ram_I.wr_mask": {
  168231. "hide_name": 0,
  168232. "bits": [ 565, 565, 565, 565, 565, 565, 565, 565 ],
  168233. "attributes": {
  168234. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[0].ram_I wr_mask",
  168235. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  168236. }
  168237. },
  168238. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  168239. "hide_name": 0,
  168240. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168241. "attributes": {
  168242. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  168243. "nosync": "00000000000000000000000000000001",
  168244. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168245. }
  168246. },
  168247. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  168248. "hide_name": 0,
  168249. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168250. "attributes": {
  168251. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  168252. "nosync": "00000000000000000000000000000001",
  168253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168254. }
  168255. },
  168256. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  168257. "hide_name": 0,
  168258. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168259. "attributes": {
  168260. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  168261. "nosync": "00000000000000000000000000000001",
  168262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168263. }
  168264. },
  168265. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.genblk1.submask": {
  168266. "hide_name": 0,
  168267. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  168268. "attributes": {
  168269. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I genblk1.submask",
  168270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  168271. "unused_bits": "8 9 10 11 12 13 14 15"
  168272. }
  168273. },
  168274. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.genblk2.genblk1.genblk1.ebr_I_MASK": {
  168275. "hide_name": 0,
  168276. "bits": [ 525, 526, 426, 427, 525, 526, 535, 536, 525, 526, 426, 427, 525, 526, 537, 538 ],
  168277. "attributes": {
  168278. "defaultvalue": "0000000000000000",
  168279. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  168280. }
  168281. },
  168282. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.ram_rd_addr": {
  168283. "hide_name": 0,
  168284. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  168285. "attributes": {
  168286. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I ram_rd_addr",
  168287. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  168288. }
  168289. },
  168290. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.ram_rd_data": {
  168291. "hide_name": 0,
  168292. "bits": [ 344, 539, 391, 540, 358, 541, 146, 542, 354, 543, 390, 544, 294, 545, 374, 546 ],
  168293. "attributes": {
  168294. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I ram_rd_data",
  168295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  168296. "unused_bits": "1 3 5 7 9 11 13 15"
  168297. }
  168298. },
  168299. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.ram_wr_addr": {
  168300. "hide_name": 0,
  168301. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  168302. "attributes": {
  168303. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I ram_wr_addr",
  168304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  168305. }
  168306. },
  168307. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.ram_wr_data": {
  168308. "hide_name": 0,
  168309. "bits": [ 442, 442, 547, 547, 444, 444, 445, 445, 446, 446, 548, 548, 448, 448, 449, 449 ],
  168310. "attributes": {
  168311. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I ram_wr_data",
  168312. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  168313. }
  168314. },
  168315. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.ram_wr_mask": {
  168316. "hide_name": 0,
  168317. "bits": [ 6911, 6912, 426, 6898, 6911, 6912, 6913, 6914, 6911, 6912, 426, 6898, 6911, 6912, 6915, 6916 ],
  168318. "attributes": {
  168319. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I ram_wr_mask",
  168320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  168321. "unused_bits": "0 1 3 4 5 6 7 8 9 11 12 13 14 15"
  168322. }
  168323. },
  168324. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.rd_addr": {
  168325. "hide_name": 0,
  168326. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168327. "attributes": {
  168328. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I rd_addr",
  168329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  168330. }
  168331. },
  168332. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.rd_clk": {
  168333. "hide_name": 0,
  168334. "bits": [ 42 ],
  168335. "attributes": {
  168336. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I rd_clk",
  168337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  168338. }
  168339. },
  168340. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.rd_data": {
  168341. "hide_name": 0,
  168342. "bits": [ 344, 354, 358, 294, 391, 390, 146, 374 ],
  168343. "attributes": {
  168344. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I rd_data",
  168345. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  168346. }
  168347. },
  168348. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.rd_data_i": {
  168349. "hide_name": 0,
  168350. "bits": [ 344, 354, 358, 294, 391, 390, 146, 374, 539, 543, 541, 545, 540, 544, 542, 546 ],
  168351. "attributes": {
  168352. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I rd_data_i",
  168353. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  168354. "unused_bits": "8 9 10 11 12 13 14 15"
  168355. }
  168356. },
  168357. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.rd_ena": {
  168358. "hide_name": 0,
  168359. "bits": [ 400 ],
  168360. "attributes": {
  168361. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I rd_ena",
  168362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  168363. }
  168364. },
  168365. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.wr_addr": {
  168366. "hide_name": 0,
  168367. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  168368. "attributes": {
  168369. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I wr_addr",
  168370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  168371. }
  168372. },
  168373. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.wr_clk": {
  168374. "hide_name": 0,
  168375. "bits": [ 42 ],
  168376. "attributes": {
  168377. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I wr_clk",
  168378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  168379. }
  168380. },
  168381. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.wr_data": {
  168382. "hide_name": 0,
  168383. "bits": [ 442, 446, 444, 448, 547, 548, 445, 449 ],
  168384. "attributes": {
  168385. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I wr_data",
  168386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  168387. }
  168388. },
  168389. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.wr_ena": {
  168390. "hide_name": 0,
  168391. "bits": [ 417 ],
  168392. "attributes": {
  168393. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I wr_ena",
  168394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  168395. }
  168396. },
  168397. "cache_I.genblk1[2].tag_ram_I.genblk1[1].ram_I.wr_mask": {
  168398. "hide_name": 0,
  168399. "bits": [ 565, 565, 565, 565, "0", "0", 564, 563 ],
  168400. "attributes": {
  168401. "hdlname": "cache_I genblk1[2].tag_ram_I genblk1[1].ram_I wr_mask",
  168402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  168403. }
  168404. },
  168405. "cache_I.genblk1[2].tag_ram_I.r_addr": {
  168406. "hide_name": 0,
  168407. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168408. "attributes": {
  168409. "hdlname": "cache_I genblk1[2].tag_ram_I r_addr",
  168410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:80.24-80.30"
  168411. }
  168412. },
  168413. "cache_I.genblk1[2].tag_ram_I.r_age": {
  168414. "hide_name": 0,
  168415. "bits": [ 391, 390 ],
  168416. "attributes": {
  168417. "hdlname": "cache_I genblk1[2].tag_ram_I r_age",
  168418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:44.21-44.26"
  168419. }
  168420. },
  168421. "cache_I.genblk1[2].tag_ram_I.r_dirty": {
  168422. "hide_name": 0,
  168423. "bits": [ 146 ],
  168424. "attributes": {
  168425. "hdlname": "cache_I genblk1[2].tag_ram_I r_dirty",
  168426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:43.21-43.28"
  168427. }
  168428. },
  168429. "cache_I.genblk1[2].tag_ram_I.r_ena": {
  168430. "hide_name": 0,
  168431. "bits": [ 400 ],
  168432. "attributes": {
  168433. "hdlname": "cache_I genblk1[2].tag_ram_I r_ena",
  168434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:40.21-40.26"
  168435. }
  168436. },
  168437. "cache_I.genblk1[2].tag_ram_I.r_idx": {
  168438. "hide_name": 0,
  168439. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168440. "attributes": {
  168441. "hdlname": "cache_I genblk1[2].tag_ram_I r_idx",
  168442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:39.21-39.26"
  168443. }
  168444. },
  168445. "cache_I.genblk1[2].tag_ram_I.r_tag": {
  168446. "hide_name": 0,
  168447. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337, 344, 354, 358, 294 ],
  168448. "attributes": {
  168449. "hdlname": "cache_I genblk1[2].tag_ram_I r_tag",
  168450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:45.21-45.26"
  168451. }
  168452. },
  168453. "cache_I.genblk1[2].tag_ram_I.r_val": {
  168454. "hide_name": 0,
  168455. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337, 344, 354, 358, 294, 391, 390, 146, 374 ],
  168456. "attributes": {
  168457. "hdlname": "cache_I genblk1[2].tag_ram_I r_val",
  168458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:82.24-82.29"
  168459. }
  168460. },
  168461. "cache_I.genblk1[2].tag_ram_I.r_valid": {
  168462. "hide_name": 0,
  168463. "bits": [ 374 ],
  168464. "attributes": {
  168465. "hdlname": "cache_I genblk1[2].tag_ram_I r_valid",
  168466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:42.21-42.28"
  168467. }
  168468. },
  168469. "cache_I.genblk1[2].tag_ram_I.w_addr": {
  168470. "hide_name": 0,
  168471. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  168472. "attributes": {
  168473. "hdlname": "cache_I genblk1[2].tag_ram_I w_addr",
  168474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:78.24-78.30"
  168475. }
  168476. },
  168477. "cache_I.genblk1[2].tag_ram_I.w_addr_r": {
  168478. "hide_name": 0,
  168479. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  168480. "attributes": {
  168481. "hdlname": "cache_I genblk1[2].tag_ram_I w_addr_r",
  168482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:79.24-79.32"
  168483. }
  168484. },
  168485. "cache_I.genblk1[2].tag_ram_I.w_age": {
  168486. "hide_name": 0,
  168487. "bits": [ 554, 551 ],
  168488. "attributes": {
  168489. "hdlname": "cache_I genblk1[2].tag_ram_I w_age",
  168490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:33.21-33.26"
  168491. }
  168492. },
  168493. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2": {
  168494. "hide_name": 0,
  168495. "bits": [ 374, 121, 552, 553 ],
  168496. "attributes": {
  168497. "force_downto": "00000000000000000000000000000001",
  168498. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168499. }
  168500. },
  168501. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2": {
  168502. "hide_name": 0,
  168503. "bits": [ 391, 205, 555, 556 ],
  168504. "attributes": {
  168505. "force_downto": "00000000000000000000000000000001",
  168506. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168507. }
  168508. },
  168509. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  168510. "hide_name": 0,
  168511. "bits": [ 380, 460, 461 ],
  168512. "attributes": {
  168513. "force_downto": "00000000000000000000000000000001",
  168514. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168515. }
  168516. },
  168517. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2_O": {
  168518. "hide_name": 0,
  168519. "bits": [ 385, 137, 517, 518 ],
  168520. "attributes": {
  168521. "force_downto": "00000000000000000000000000000001",
  168522. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168523. }
  168524. },
  168525. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  168526. "hide_name": 0,
  168527. "bits": [ 558, 559 ],
  168528. "attributes": {
  168529. "force_downto": "00000000000000000000000000000001",
  168530. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168531. }
  168532. },
  168533. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_I2": {
  168534. "hide_name": 0,
  168535. "bits": [ 374, 125, 549, 550 ],
  168536. "attributes": {
  168537. "force_downto": "00000000000000000000000000000001",
  168538. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168539. }
  168540. },
  168541. "cache_I.genblk1[2].tag_ram_I.w_age_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  168542. "hide_name": 0,
  168543. "bits": [ 380, 382, 202, 461 ],
  168544. "attributes": {
  168545. "force_downto": "00000000000000000000000000000001",
  168546. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168547. }
  168548. },
  168549. "cache_I.genblk1[2].tag_ram_I.w_age_we": {
  168550. "hide_name": 0,
  168551. "bits": [ "1" ],
  168552. "attributes": {
  168553. "hdlname": "cache_I genblk1[2].tag_ram_I w_age_we",
  168554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:32.21-32.29"
  168555. }
  168556. },
  168557. "cache_I.genblk1[2].tag_ram_I.w_dirty": {
  168558. "hide_name": 0,
  168559. "bits": [ 125 ],
  168560. "attributes": {
  168561. "hdlname": "cache_I genblk1[2].tag_ram_I w_dirty",
  168562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:30.21-30.28"
  168563. }
  168564. },
  168565. "cache_I.genblk1[2].tag_ram_I.w_ena": {
  168566. "hide_name": 0,
  168567. "bits": [ 465 ],
  168568. "attributes": {
  168569. "hdlname": "cache_I genblk1[2].tag_ram_I w_ena",
  168570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:24.21-24.26"
  168571. }
  168572. },
  168573. "cache_I.genblk1[2].tag_ram_I.w_ena_r": {
  168574. "hide_name": 0,
  168575. "bits": [ 417 ],
  168576. "attributes": {
  168577. "hdlname": "cache_I genblk1[2].tag_ram_I w_ena_r",
  168578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:88.7-88.14"
  168579. }
  168580. },
  168581. "cache_I.genblk1[2].tag_ram_I.w_idx": {
  168582. "hide_name": 0,
  168583. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  168584. "attributes": {
  168585. "hdlname": "cache_I genblk1[2].tag_ram_I w_idx",
  168586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:23.21-23.26"
  168587. }
  168588. },
  168589. "cache_I.genblk1[2].tag_ram_I.w_msk": {
  168590. "hide_name": 0,
  168591. "bits": [ 560, 560, 560, 560, 560, 560, 560, 560, 560, 560, 560, 560, "0", "0", 562, 561 ],
  168592. "attributes": {
  168593. "hdlname": "cache_I genblk1[2].tag_ram_I w_msk",
  168594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:85.24-85.29"
  168595. }
  168596. },
  168597. "cache_I.genblk1[2].tag_ram_I.w_msk_SB_LUT4_O_I3": {
  168598. "hide_name": 0,
  168599. "bits": [ 390, 391, 383, 557 ],
  168600. "attributes": {
  168601. "force_downto": "00000000000000000000000000000001",
  168602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  168603. }
  168604. },
  168605. "cache_I.genblk1[2].tag_ram_I.w_msk_r": {
  168606. "hide_name": 0,
  168607. "bits": [ 565, 565, 565, 565, 565, 565, 565, 565, 565, 565, 565, 565, "0", "0", 564, 563 ],
  168608. "attributes": {
  168609. "hdlname": "cache_I genblk1[2].tag_ram_I w_msk_r",
  168610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:86.24-86.31"
  168611. }
  168612. },
  168613. "cache_I.genblk1[2].tag_ram_I.w_msk_r_SB_LUT4_I3_O": {
  168614. "hide_name": 0,
  168615. "bits": [ 525, 526, 525, 526, 525, 526, 525, 526, 525, 526, 525, 526, 525, 526, 525, 526 ],
  168616. "attributes": {
  168617. "defaultvalue": "0000000000000000",
  168618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  168619. }
  168620. },
  168621. "cache_I.genblk1[2].tag_ram_I.w_tag": {
  168622. "hide_name": 0,
  168623. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  168624. "attributes": {
  168625. "hdlname": "cache_I genblk1[2].tag_ram_I w_tag",
  168626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:36.21-36.26"
  168627. }
  168628. },
  168629. "cache_I.genblk1[2].tag_ram_I.w_val": {
  168630. "hide_name": 0,
  168631. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480, 554, 551, 125, 121 ],
  168632. "attributes": {
  168633. "hdlname": "cache_I genblk1[2].tag_ram_I w_val",
  168634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:83.24-83.29"
  168635. }
  168636. },
  168637. "cache_I.genblk1[2].tag_ram_I.w_val_r": {
  168638. "hide_name": 0,
  168639. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425, 442, 446, 444, 448, 547, 548, 445, 449 ],
  168640. "attributes": {
  168641. "hdlname": "cache_I genblk1[2].tag_ram_I w_val_r",
  168642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:84.24-84.31"
  168643. }
  168644. },
  168645. "cache_I.genblk1[2].tag_ram_I.w_valid": {
  168646. "hide_name": 0,
  168647. "bits": [ 121 ],
  168648. "attributes": {
  168649. "hdlname": "cache_I genblk1[2].tag_ram_I w_valid",
  168650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:27.21-27.28"
  168651. }
  168652. },
  168653. "cache_I.genblk1[3].tag_ram_I.clk": {
  168654. "hide_name": 0,
  168655. "bits": [ 42 ],
  168656. "attributes": {
  168657. "hdlname": "cache_I genblk1[3].tag_ram_I clk",
  168658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:48.21-48.24"
  168659. }
  168660. },
  168661. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  168662. "hide_name": 0,
  168663. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168664. "attributes": {
  168665. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  168666. "nosync": "00000000000000000000000000000001",
  168667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168668. }
  168669. },
  168670. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  168671. "hide_name": 0,
  168672. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168673. "attributes": {
  168674. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  168675. "nosync": "00000000000000000000000000000001",
  168676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168677. }
  168678. },
  168679. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  168680. "hide_name": 0,
  168681. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168682. "attributes": {
  168683. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  168684. "nosync": "00000000000000000000000000000001",
  168685. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168686. }
  168687. },
  168688. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.genblk1.submask": {
  168689. "hide_name": 0,
  168690. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  168691. "attributes": {
  168692. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I genblk1.submask",
  168693. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  168694. "unused_bits": "8 9 10 11 12 13 14 15"
  168695. }
  168696. },
  168697. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.ram_rd_addr": {
  168698. "hide_name": 0,
  168699. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  168700. "attributes": {
  168701. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I ram_rd_addr",
  168702. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  168703. }
  168704. },
  168705. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.ram_rd_data": {
  168706. "hide_name": 0,
  168707. "bits": [ 301, 568, 318, 569, 303, 570, 331, 571, 389, 572, 323, 573, 312, 574, 340, 575 ],
  168708. "attributes": {
  168709. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I ram_rd_data",
  168710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  168711. "unused_bits": "1 3 5 7 9 11 13 15"
  168712. }
  168713. },
  168714. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.ram_wr_addr": {
  168715. "hide_name": 0,
  168716. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  168717. "attributes": {
  168718. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I ram_wr_addr",
  168719. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  168720. }
  168721. },
  168722. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.ram_wr_data": {
  168723. "hide_name": 0,
  168724. "bits": [ 418, 418, 419, 419, 420, 420, 421, 421, 422, 422, 423, 423, 424, 424, 425, 425 ],
  168725. "attributes": {
  168726. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I ram_wr_data",
  168727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  168728. }
  168729. },
  168730. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.ram_wr_mask": {
  168731. "hide_name": 0,
  168732. "bits": [ 6917, 6918, 6917, 6918, 6917, 6918, 6917, 6918, 6917, 6918, 6917, 6918, 6917, 6918, 6917, 6918 ],
  168733. "attributes": {
  168734. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I ram_wr_mask",
  168735. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  168736. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15"
  168737. }
  168738. },
  168739. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.rd_addr": {
  168740. "hide_name": 0,
  168741. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168742. "attributes": {
  168743. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I rd_addr",
  168744. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  168745. }
  168746. },
  168747. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.rd_clk": {
  168748. "hide_name": 0,
  168749. "bits": [ 42 ],
  168750. "attributes": {
  168751. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I rd_clk",
  168752. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  168753. }
  168754. },
  168755. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.rd_data": {
  168756. "hide_name": 0,
  168757. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340 ],
  168758. "attributes": {
  168759. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I rd_data",
  168760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  168761. }
  168762. },
  168763. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.rd_data_i": {
  168764. "hide_name": 0,
  168765. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340, 568, 572, 570, 574, 569, 573, 571, 575 ],
  168766. "attributes": {
  168767. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I rd_data_i",
  168768. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  168769. "unused_bits": "8 9 10 11 12 13 14 15"
  168770. }
  168771. },
  168772. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.rd_ena": {
  168773. "hide_name": 0,
  168774. "bits": [ 400 ],
  168775. "attributes": {
  168776. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I rd_ena",
  168777. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  168778. }
  168779. },
  168780. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.wr_addr": {
  168781. "hide_name": 0,
  168782. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  168783. "attributes": {
  168784. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I wr_addr",
  168785. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  168786. }
  168787. },
  168788. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.wr_clk": {
  168789. "hide_name": 0,
  168790. "bits": [ 42 ],
  168791. "attributes": {
  168792. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I wr_clk",
  168793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  168794. }
  168795. },
  168796. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.wr_data": {
  168797. "hide_name": 0,
  168798. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425 ],
  168799. "attributes": {
  168800. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I wr_data",
  168801. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  168802. }
  168803. },
  168804. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.wr_ena": {
  168805. "hide_name": 0,
  168806. "bits": [ 417 ],
  168807. "attributes": {
  168808. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I wr_ena",
  168809. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  168810. }
  168811. },
  168812. "cache_I.genblk1[3].tag_ram_I.genblk1[0].ram_I.wr_mask": {
  168813. "hide_name": 0,
  168814. "bits": [ 604, 604, 604, 604, 604, 604, 604, 604 ],
  168815. "attributes": {
  168816. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[0].ram_I wr_mask",
  168817. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  168818. }
  168819. },
  168820. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig": {
  168821. "hide_name": 0,
  168822. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168823. "attributes": {
  168824. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:104$4650.sig",
  168825. "nosync": "00000000000000000000000000000001",
  168826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168827. }
  168828. },
  168829. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig": {
  168830. "hide_name": 0,
  168831. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168832. "attributes": {
  168833. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:105$4651.sig",
  168834. "nosync": "00000000000000000000000000000001",
  168835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168836. }
  168837. },
  168838. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig": {
  168839. "hide_name": 0,
  168840. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  168841. "attributes": {
  168842. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I bitrev16$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:81$4649.sig",
  168843. "nosync": "00000000000000000000000000000001",
  168844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:54.41-54.44"
  168845. }
  168846. },
  168847. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.genblk1.submask": {
  168848. "hide_name": 0,
  168849. "bits": [ 426, 426, 426, 426, 426, 426, 426, 426, 6898, 6898, 6898, 6898, 6898, 6898, 6898, 6898 ],
  168850. "attributes": {
  168851. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I genblk1.submask",
  168852. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:102.16-102.23",
  168853. "unused_bits": "8 9 10 11 12 13 14 15"
  168854. }
  168855. },
  168856. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.ram_rd_addr": {
  168857. "hide_name": 0,
  168858. "bits": [ 38, 39, 40, 41, 396, 397, 398, 399, 37, "0", "0" ],
  168859. "attributes": {
  168860. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I ram_rd_addr",
  168861. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:70.14-70.25"
  168862. }
  168863. },
  168864. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.ram_rd_data": {
  168865. "hide_name": 0,
  168866. "bits": [ 347, 580, 382, 581, 361, 582, 143, 583, 351, 584, 380, 585, 292, 586, 381, 587 ],
  168867. "attributes": {
  168868. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I ram_rd_data",
  168869. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:71.14-71.25",
  168870. "unused_bits": "1 3 5 7 9 11 13 15"
  168871. }
  168872. },
  168873. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.ram_wr_addr": {
  168874. "hide_name": 0,
  168875. "bits": [ 409, 410, 411, 412, 413, 414, 415, 416, "0", "0", "0" ],
  168876. "attributes": {
  168877. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I ram_wr_addr",
  168878. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:66.14-66.25"
  168879. }
  168880. },
  168881. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.ram_wr_data": {
  168882. "hide_name": 0,
  168883. "bits": [ 442, 442, 588, 588, 444, 444, 445, 445, 446, 446, 589, 589, 448, 448, 449, 449 ],
  168884. "attributes": {
  168885. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I ram_wr_data",
  168886. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:67.14-67.25"
  168887. }
  168888. },
  168889. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.ram_wr_mask": {
  168890. "hide_name": 0,
  168891. "bits": [ 6917, 6918, 426, 6898, 6917, 6918, 6919, 6920, 6917, 6918, 426, 6898, 6917, 6918, 6921, 6922 ],
  168892. "attributes": {
  168893. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I ram_wr_mask",
  168894. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:68.14-68.25",
  168895. "unused_bits": "0 1 3 4 5 6 7 8 9 11 12 13 14 15"
  168896. }
  168897. },
  168898. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.rd_addr": {
  168899. "hide_name": 0,
  168900. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168901. "attributes": {
  168902. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I rd_addr",
  168903. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:34.24-34.31"
  168904. }
  168905. },
  168906. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.rd_clk": {
  168907. "hide_name": 0,
  168908. "bits": [ 42 ],
  168909. "attributes": {
  168910. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I rd_clk",
  168911. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:37.24-37.30"
  168912. }
  168913. },
  168914. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.rd_data": {
  168915. "hide_name": 0,
  168916. "bits": [ 347, 351, 361, 292, 382, 380, 143, 381 ],
  168917. "attributes": {
  168918. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I rd_data",
  168919. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:35.24-35.31"
  168920. }
  168921. },
  168922. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.rd_data_i": {
  168923. "hide_name": 0,
  168924. "bits": [ 347, 351, 361, 292, 382, 380, 143, 381, 580, 584, 582, 586, 581, 585, 583, 587 ],
  168925. "attributes": {
  168926. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I rd_data_i",
  168927. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:77.14-77.23",
  168928. "unused_bits": "8 9 10 11 12 13 14 15"
  168929. }
  168930. },
  168931. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.rd_ena": {
  168932. "hide_name": 0,
  168933. "bits": [ 400 ],
  168934. "attributes": {
  168935. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I rd_ena",
  168936. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:36.24-36.30"
  168937. }
  168938. },
  168939. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.wr_addr": {
  168940. "hide_name": 0,
  168941. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  168942. "attributes": {
  168943. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I wr_addr",
  168944. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:27.24-27.31"
  168945. }
  168946. },
  168947. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.wr_clk": {
  168948. "hide_name": 0,
  168949. "bits": [ 42 ],
  168950. "attributes": {
  168951. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I wr_clk",
  168952. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:31.24-31.30"
  168953. }
  168954. },
  168955. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.wr_data": {
  168956. "hide_name": 0,
  168957. "bits": [ 442, 446, 444, 448, 588, 589, 445, 449 ],
  168958. "attributes": {
  168959. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I wr_data",
  168960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:28.24-28.31"
  168961. }
  168962. },
  168963. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.wr_ena": {
  168964. "hide_name": 0,
  168965. "bits": [ 417 ],
  168966. "attributes": {
  168967. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I wr_ena",
  168968. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:30.24-30.30"
  168969. }
  168970. },
  168971. "cache_I.genblk1[3].tag_ram_I.genblk1[1].ram_I.wr_mask": {
  168972. "hide_name": 0,
  168973. "bits": [ 604, 604, 604, 604, "0", "0", 603, 602 ],
  168974. "attributes": {
  168975. "hdlname": "cache_I genblk1[3].tag_ram_I genblk1[1].ram_I wr_mask",
  168976. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:29.24-29.31"
  168977. }
  168978. },
  168979. "cache_I.genblk1[3].tag_ram_I.r_addr": {
  168980. "hide_name": 0,
  168981. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  168982. "attributes": {
  168983. "hdlname": "cache_I genblk1[3].tag_ram_I r_addr",
  168984. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:80.24-80.30"
  168985. }
  168986. },
  168987. "cache_I.genblk1[3].tag_ram_I.r_age": {
  168988. "hide_name": 0,
  168989. "bits": [ 382, 380 ],
  168990. "attributes": {
  168991. "hdlname": "cache_I genblk1[3].tag_ram_I r_age",
  168992. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:44.21-44.26"
  168993. }
  168994. },
  168995. "cache_I.genblk1[3].tag_ram_I.r_dirty": {
  168996. "hide_name": 0,
  168997. "bits": [ 143 ],
  168998. "attributes": {
  168999. "hdlname": "cache_I genblk1[3].tag_ram_I r_dirty",
  169000. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:43.21-43.28"
  169001. }
  169002. },
  169003. "cache_I.genblk1[3].tag_ram_I.r_ena": {
  169004. "hide_name": 0,
  169005. "bits": [ 400 ],
  169006. "attributes": {
  169007. "hdlname": "cache_I genblk1[3].tag_ram_I r_ena",
  169008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:40.21-40.26"
  169009. }
  169010. },
  169011. "cache_I.genblk1[3].tag_ram_I.r_idx": {
  169012. "hide_name": 0,
  169013. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  169014. "attributes": {
  169015. "hdlname": "cache_I genblk1[3].tag_ram_I r_idx",
  169016. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:39.21-39.26"
  169017. }
  169018. },
  169019. "cache_I.genblk1[3].tag_ram_I.r_tag": {
  169020. "hide_name": 0,
  169021. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340, 347, 351, 361, 292 ],
  169022. "attributes": {
  169023. "hdlname": "cache_I genblk1[3].tag_ram_I r_tag",
  169024. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:45.21-45.26"
  169025. }
  169026. },
  169027. "cache_I.genblk1[3].tag_ram_I.r_val": {
  169028. "hide_name": 0,
  169029. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340, 347, 351, 361, 292, 382, 380, 143, 381 ],
  169030. "attributes": {
  169031. "hdlname": "cache_I genblk1[3].tag_ram_I r_val",
  169032. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:82.24-82.29"
  169033. }
  169034. },
  169035. "cache_I.genblk1[3].tag_ram_I.r_valid": {
  169036. "hide_name": 0,
  169037. "bits": [ 381 ],
  169038. "attributes": {
  169039. "hdlname": "cache_I genblk1[3].tag_ram_I r_valid",
  169040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:42.21-42.28"
  169041. }
  169042. },
  169043. "cache_I.genblk1[3].tag_ram_I.w_addr": {
  169044. "hide_name": 0,
  169045. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  169046. "attributes": {
  169047. "hdlname": "cache_I genblk1[3].tag_ram_I w_addr",
  169048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:78.24-78.30"
  169049. }
  169050. },
  169051. "cache_I.genblk1[3].tag_ram_I.w_addr_r": {
  169052. "hide_name": 0,
  169053. "bits": [ 426, 409, 410, 411, 412, 413, 414, 415, 416 ],
  169054. "attributes": {
  169055. "hdlname": "cache_I genblk1[3].tag_ram_I w_addr_r",
  169056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:79.24-79.32"
  169057. }
  169058. },
  169059. "cache_I.genblk1[3].tag_ram_I.w_age": {
  169060. "hide_name": 0,
  169061. "bits": [ 595, 592 ],
  169062. "attributes": {
  169063. "hdlname": "cache_I genblk1[3].tag_ram_I w_age",
  169064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:33.21-33.26"
  169065. }
  169066. },
  169067. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1_I2": {
  169068. "hide_name": 0,
  169069. "bits": [ 381, 121, 593, 594 ],
  169070. "attributes": {
  169071. "force_downto": "00000000000000000000000000000001",
  169072. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169073. }
  169074. },
  169075. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2": {
  169076. "hide_name": 0,
  169077. "bits": [ 382, 202, 597, 598 ],
  169078. "attributes": {
  169079. "force_downto": "00000000000000000000000000000001",
  169080. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169081. }
  169082. },
  169083. "cache_I.genblk1[3].tag_ram_I.w_age_SB_LUT4_O_I2": {
  169084. "hide_name": 0,
  169085. "bits": [ 381, 125, 590, 591 ],
  169086. "attributes": {
  169087. "force_downto": "00000000000000000000000000000001",
  169088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169089. }
  169090. },
  169091. "cache_I.genblk1[3].tag_ram_I.w_age_we": {
  169092. "hide_name": 0,
  169093. "bits": [ "1" ],
  169094. "attributes": {
  169095. "hdlname": "cache_I genblk1[3].tag_ram_I w_age_we",
  169096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:32.21-32.29"
  169097. }
  169098. },
  169099. "cache_I.genblk1[3].tag_ram_I.w_dirty": {
  169100. "hide_name": 0,
  169101. "bits": [ 125 ],
  169102. "attributes": {
  169103. "hdlname": "cache_I genblk1[3].tag_ram_I w_dirty",
  169104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:30.21-30.28"
  169105. }
  169106. },
  169107. "cache_I.genblk1[3].tag_ram_I.w_ena": {
  169108. "hide_name": 0,
  169109. "bits": [ 465 ],
  169110. "attributes": {
  169111. "hdlname": "cache_I genblk1[3].tag_ram_I w_ena",
  169112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:24.21-24.26"
  169113. }
  169114. },
  169115. "cache_I.genblk1[3].tag_ram_I.w_ena_r": {
  169116. "hide_name": 0,
  169117. "bits": [ 417 ],
  169118. "attributes": {
  169119. "hdlname": "cache_I genblk1[3].tag_ram_I w_ena_r",
  169120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:88.7-88.14"
  169121. }
  169122. },
  169123. "cache_I.genblk1[3].tag_ram_I.w_idx": {
  169124. "hide_name": 0,
  169125. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  169126. "attributes": {
  169127. "hdlname": "cache_I genblk1[3].tag_ram_I w_idx",
  169128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:23.21-23.26"
  169129. }
  169130. },
  169131. "cache_I.genblk1[3].tag_ram_I.w_msk": {
  169132. "hide_name": 0,
  169133. "bits": [ 599, 599, 599, 599, 599, 599, 599, 599, 599, 599, 599, 599, "0", "0", 601, 600 ],
  169134. "attributes": {
  169135. "hdlname": "cache_I genblk1[3].tag_ram_I w_msk",
  169136. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:85.24-85.29"
  169137. }
  169138. },
  169139. "cache_I.genblk1[3].tag_ram_I.w_msk_SB_LUT4_O_I3": {
  169140. "hide_name": 0,
  169141. "bits": [ 380, 382, 383, 596 ],
  169142. "attributes": {
  169143. "force_downto": "00000000000000000000000000000001",
  169144. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169145. }
  169146. },
  169147. "cache_I.genblk1[3].tag_ram_I.w_msk_r": {
  169148. "hide_name": 0,
  169149. "bits": [ 604, 604, 604, 604, 604, 604, 604, 604, 604, 604, 604, 604, "0", "0", 603, 602 ],
  169150. "attributes": {
  169151. "hdlname": "cache_I genblk1[3].tag_ram_I w_msk_r",
  169152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:86.24-86.31"
  169153. }
  169154. },
  169155. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_5_O": {
  169156. "hide_name": 0,
  169157. "bits": [ 566, 567, 426, 427, 566, 567, 576, 577, 566, 567, 426, 427, 566, 567, 578, 579 ],
  169158. "attributes": {
  169159. "defaultvalue": "0000000000000000",
  169160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  169161. }
  169162. },
  169163. "cache_I.genblk1[3].tag_ram_I.w_msk_r_SB_LUT4_I3_O": {
  169164. "hide_name": 0,
  169165. "bits": [ 566, 567, 566, 567, 566, 567, 566, 567, 566, 567, 566, 567, 566, 567, 566, 567 ],
  169166. "attributes": {
  169167. "defaultvalue": "0000000000000000",
  169168. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_ebr.v:161.6-173.5|/usr/bin/../share/yosys/ice40/cells_sim.v:1872.16-1872.20"
  169169. }
  169170. },
  169171. "cache_I.genblk1[3].tag_ram_I.w_tag": {
  169172. "hide_name": 0,
  169173. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169174. "attributes": {
  169175. "hdlname": "cache_I genblk1[3].tag_ram_I w_tag",
  169176. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:36.21-36.26"
  169177. }
  169178. },
  169179. "cache_I.genblk1[3].tag_ram_I.w_val": {
  169180. "hide_name": 0,
  169181. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480, 595, 592, 125, 121 ],
  169182. "attributes": {
  169183. "hdlname": "cache_I genblk1[3].tag_ram_I w_val",
  169184. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:83.24-83.29"
  169185. }
  169186. },
  169187. "cache_I.genblk1[3].tag_ram_I.w_val_r": {
  169188. "hide_name": 0,
  169189. "bits": [ 418, 422, 420, 424, 419, 423, 421, 425, 442, 446, 444, 448, 588, 589, 445, 449 ],
  169190. "attributes": {
  169191. "hdlname": "cache_I genblk1[3].tag_ram_I w_val_r",
  169192. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:84.24-84.31"
  169193. }
  169194. },
  169195. "cache_I.genblk1[3].tag_ram_I.w_valid": {
  169196. "hide_name": 0,
  169197. "bits": [ 121 ],
  169198. "attributes": {
  169199. "hdlname": "cache_I genblk1[3].tag_ram_I w_valid",
  169200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_ram.v:27.21-27.28"
  169201. }
  169202. },
  169203. "cache_I.genblk2[0].tag_match_I.agg_in": {
  169204. "hide_name": 0,
  169205. "bits": [ 608, 609, 610, 611, 612, 613, 378, "1" ],
  169206. "attributes": {
  169207. "hdlname": "cache_I genblk2[0].tag_match_I agg_in",
  169208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:37.20-37.26"
  169209. }
  169210. },
  169211. "cache_I.genblk2[0].tag_match_I.agg_out": {
  169212. "hide_name": 0,
  169213. "bits": [ 606, 605 ],
  169214. "attributes": {
  169215. "hdlname": "cache_I genblk2[0].tag_match_I agg_out",
  169216. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:38.20-38.27"
  169217. }
  169218. },
  169219. "cache_I.genblk2[0].tag_match_I.agg_out_SB_LUT4_I2_O": {
  169220. "hide_name": 0,
  169221. "bits": [ 438, 457, 462 ],
  169222. "attributes": {
  169223. "force_downto": "00000000000000000000000000000001",
  169224. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169225. }
  169226. },
  169227. "cache_I.genblk2[0].tag_match_I.cmp_in0": {
  169228. "hide_name": 0,
  169229. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169230. "attributes": {
  169231. "hdlname": "cache_I genblk2[0].tag_match_I cmp_in0",
  169232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:33.20-33.27"
  169233. }
  169234. },
  169235. "cache_I.genblk2[0].tag_match_I.cmp_in1": {
  169236. "hide_name": 0,
  169237. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339, 346, 352, 360, 291 ],
  169238. "attributes": {
  169239. "hdlname": "cache_I genblk2[0].tag_match_I cmp_in1",
  169240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:34.20-34.27"
  169241. }
  169242. },
  169243. "cache_I.genblk2[0].tag_match_I.cmp_out": {
  169244. "hide_name": 0,
  169245. "bits": [ 608, 609, 610, 611, 612, 613 ],
  169246. "attributes": {
  169247. "hdlname": "cache_I genblk2[0].tag_match_I cmp_out",
  169248. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:35.20-35.27"
  169249. }
  169250. },
  169251. "cache_I.genblk2[0].tag_match_I.ref": {
  169252. "hide_name": 0,
  169253. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169254. "attributes": {
  169255. "hdlname": "cache_I genblk2[0].tag_match_I ref",
  169256. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:15.30-15.33"
  169257. }
  169258. },
  169259. "cache_I.genblk2[0].tag_match_I.tag": {
  169260. "hide_name": 0,
  169261. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339, 346, 352, 360, 291 ],
  169262. "attributes": {
  169263. "hdlname": "cache_I genblk2[0].tag_match_I tag",
  169264. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:16.30-16.33"
  169265. }
  169266. },
  169267. "cache_I.genblk2[0].tag_match_I.valid": {
  169268. "hide_name": 0,
  169269. "bits": [ 378 ],
  169270. "attributes": {
  169271. "hdlname": "cache_I genblk2[0].tag_match_I valid",
  169272. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:17.14-17.19"
  169273. }
  169274. },
  169275. "cache_I.genblk2[1].tag_match_I.agg_in": {
  169276. "hide_name": 0,
  169277. "bits": [ 616, 617, 618, 619, 620, 621, 379, "1" ],
  169278. "attributes": {
  169279. "hdlname": "cache_I genblk2[1].tag_match_I agg_in",
  169280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:37.20-37.26"
  169281. }
  169282. },
  169283. "cache_I.genblk2[1].tag_match_I.agg_out": {
  169284. "hide_name": 0,
  169285. "bits": [ 615, 614 ],
  169286. "attributes": {
  169287. "hdlname": "cache_I genblk2[1].tag_match_I agg_out",
  169288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:38.20-38.27"
  169289. }
  169290. },
  169291. "cache_I.genblk2[1].tag_match_I.cmp_in0": {
  169292. "hide_name": 0,
  169293. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169294. "attributes": {
  169295. "hdlname": "cache_I genblk2[1].tag_match_I cmp_in0",
  169296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:33.20-33.27"
  169297. }
  169298. },
  169299. "cache_I.genblk2[1].tag_match_I.cmp_in1": {
  169300. "hide_name": 0,
  169301. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338, 345, 353, 359, 293 ],
  169302. "attributes": {
  169303. "hdlname": "cache_I genblk2[1].tag_match_I cmp_in1",
  169304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:34.20-34.27"
  169305. }
  169306. },
  169307. "cache_I.genblk2[1].tag_match_I.cmp_out": {
  169308. "hide_name": 0,
  169309. "bits": [ 616, 617, 618, 619, 620, 621 ],
  169310. "attributes": {
  169311. "hdlname": "cache_I genblk2[1].tag_match_I cmp_out",
  169312. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:35.20-35.27"
  169313. }
  169314. },
  169315. "cache_I.genblk2[1].tag_match_I.ref": {
  169316. "hide_name": 0,
  169317. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169318. "attributes": {
  169319. "hdlname": "cache_I genblk2[1].tag_match_I ref",
  169320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:15.30-15.33"
  169321. }
  169322. },
  169323. "cache_I.genblk2[1].tag_match_I.tag": {
  169324. "hide_name": 0,
  169325. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338, 345, 353, 359, 293 ],
  169326. "attributes": {
  169327. "hdlname": "cache_I genblk2[1].tag_match_I tag",
  169328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:16.30-16.33"
  169329. }
  169330. },
  169331. "cache_I.genblk2[1].tag_match_I.valid": {
  169332. "hide_name": 0,
  169333. "bits": [ 379 ],
  169334. "attributes": {
  169335. "hdlname": "cache_I genblk2[1].tag_match_I valid",
  169336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:17.14-17.19"
  169337. }
  169338. },
  169339. "cache_I.genblk2[2].tag_match_I.agg_in": {
  169340. "hide_name": 0,
  169341. "bits": [ 624, 625, 626, 627, 628, 629, 374, "1" ],
  169342. "attributes": {
  169343. "hdlname": "cache_I genblk2[2].tag_match_I agg_in",
  169344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:37.20-37.26"
  169345. }
  169346. },
  169347. "cache_I.genblk2[2].tag_match_I.agg_out": {
  169348. "hide_name": 0,
  169349. "bits": [ 623, 622 ],
  169350. "attributes": {
  169351. "hdlname": "cache_I genblk2[2].tag_match_I agg_out",
  169352. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:38.20-38.27"
  169353. }
  169354. },
  169355. "cache_I.genblk2[2].tag_match_I.agg_out_SB_LUT4_I2_O": {
  169356. "hide_name": 0,
  169357. "bits": [ 384, 390, 204, 205 ],
  169358. "attributes": {
  169359. "force_downto": "00000000000000000000000000000001",
  169360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169361. }
  169362. },
  169363. "cache_I.genblk2[2].tag_match_I.cmp_in0": {
  169364. "hide_name": 0,
  169365. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169366. "attributes": {
  169367. "hdlname": "cache_I genblk2[2].tag_match_I cmp_in0",
  169368. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:33.20-33.27"
  169369. }
  169370. },
  169371. "cache_I.genblk2[2].tag_match_I.cmp_in1": {
  169372. "hide_name": 0,
  169373. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337, 344, 354, 358, 294 ],
  169374. "attributes": {
  169375. "hdlname": "cache_I genblk2[2].tag_match_I cmp_in1",
  169376. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:34.20-34.27"
  169377. }
  169378. },
  169379. "cache_I.genblk2[2].tag_match_I.cmp_out": {
  169380. "hide_name": 0,
  169381. "bits": [ 624, 625, 626, 627, 628, 629 ],
  169382. "attributes": {
  169383. "hdlname": "cache_I genblk2[2].tag_match_I cmp_out",
  169384. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:35.20-35.27"
  169385. }
  169386. },
  169387. "cache_I.genblk2[2].tag_match_I.ref": {
  169388. "hide_name": 0,
  169389. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169390. "attributes": {
  169391. "hdlname": "cache_I genblk2[2].tag_match_I ref",
  169392. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:15.30-15.33"
  169393. }
  169394. },
  169395. "cache_I.genblk2[2].tag_match_I.tag": {
  169396. "hide_name": 0,
  169397. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337, 344, 354, 358, 294 ],
  169398. "attributes": {
  169399. "hdlname": "cache_I genblk2[2].tag_match_I tag",
  169400. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:16.30-16.33"
  169401. }
  169402. },
  169403. "cache_I.genblk2[2].tag_match_I.valid": {
  169404. "hide_name": 0,
  169405. "bits": [ 374 ],
  169406. "attributes": {
  169407. "hdlname": "cache_I genblk2[2].tag_match_I valid",
  169408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:17.14-17.19"
  169409. }
  169410. },
  169411. "cache_I.genblk2[3].tag_match_I.agg_in": {
  169412. "hide_name": 0,
  169413. "bits": [ 632, 633, 634, 635, 636, 637, 381, "1" ],
  169414. "attributes": {
  169415. "hdlname": "cache_I genblk2[3].tag_match_I agg_in",
  169416. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:37.20-37.26"
  169417. }
  169418. },
  169419. "cache_I.genblk2[3].tag_match_I.agg_out": {
  169420. "hide_name": 0,
  169421. "bits": [ 631, 630 ],
  169422. "attributes": {
  169423. "hdlname": "cache_I genblk2[3].tag_match_I agg_out",
  169424. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:38.20-38.27"
  169425. }
  169426. },
  169427. "cache_I.genblk2[3].tag_match_I.agg_out_SB_LUT4_I2_O": {
  169428. "hide_name": 0,
  169429. "bits": [ 380, 202, 607 ],
  169430. "attributes": {
  169431. "force_downto": "00000000000000000000000000000001",
  169432. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169433. }
  169434. },
  169435. "cache_I.genblk2[3].tag_match_I.cmp_in0": {
  169436. "hide_name": 0,
  169437. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169438. "attributes": {
  169439. "hdlname": "cache_I genblk2[3].tag_match_I cmp_in0",
  169440. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:33.20-33.27"
  169441. }
  169442. },
  169443. "cache_I.genblk2[3].tag_match_I.cmp_in1": {
  169444. "hide_name": 0,
  169445. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340, 347, 351, 361, 292 ],
  169446. "attributes": {
  169447. "hdlname": "cache_I genblk2[3].tag_match_I cmp_in1",
  169448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:34.20-34.27"
  169449. }
  169450. },
  169451. "cache_I.genblk2[3].tag_match_I.cmp_out": {
  169452. "hide_name": 0,
  169453. "bits": [ 632, 633, 634, 635, 636, 637 ],
  169454. "attributes": {
  169455. "hdlname": "cache_I genblk2[3].tag_match_I cmp_out",
  169456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:35.20-35.27"
  169457. }
  169458. },
  169459. "cache_I.genblk2[3].tag_match_I.ref": {
  169460. "hide_name": 0,
  169461. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169462. "attributes": {
  169463. "hdlname": "cache_I genblk2[3].tag_match_I ref",
  169464. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:15.30-15.33"
  169465. }
  169466. },
  169467. "cache_I.genblk2[3].tag_match_I.tag": {
  169468. "hide_name": 0,
  169469. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340, 347, 351, 361, 292 ],
  169470. "attributes": {
  169471. "hdlname": "cache_I genblk2[3].tag_match_I tag",
  169472. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:16.30-16.33"
  169473. }
  169474. },
  169475. "cache_I.genblk2[3].tag_match_I.valid": {
  169476. "hide_name": 0,
  169477. "bits": [ 381 ],
  169478. "attributes": {
  169479. "hdlname": "cache_I genblk2[3].tag_match_I valid",
  169480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_tag_match.v:17.14-17.19"
  169481. }
  169482. },
  169483. "cache_I.hit.w": {
  169484. "hide_name": 0,
  169485. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  169486. "signed": 1,
  169487. "attributes": {
  169488. "hdlname": "cache_I hit.w",
  169489. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:311.11-311.12"
  169490. }
  169491. },
  169492. "cache_I.lu_hit": {
  169493. "hide_name": 0,
  169494. "bits": [ 464 ],
  169495. "attributes": {
  169496. "hdlname": "cache_I lu_hit",
  169497. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:139.14-139.20"
  169498. }
  169499. },
  169500. "cache_I.lu_hit_SB_DFFR_D_Q": {
  169501. "hide_name": 0,
  169502. "bits": [ 916, 470, 939, 638 ],
  169503. "attributes": {
  169504. "force_downto": "00000000000000000000000000000001",
  169505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169506. }
  169507. },
  169508. "cache_I.mi_addr": {
  169509. "hide_name": 0,
  169510. "bits": [ "0", "0", "0", 152, 153, 154, 155, 156, 157, 158, 159, 160, 6923, 6924, 6925, 6926, 6927, 6928, 6929, 6930, 6931, 6932, 6933, 6934 ],
  169511. "attributes": {
  169512. "hdlname": "cache_I mi_addr",
  169513. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:36.21-36.28",
  169514. "unused_bits": "12 13 14 15 16 17 18 19 20 21 22 23"
  169515. }
  169516. },
  169517. "cache_I.mi_len": {
  169518. "hide_name": 0,
  169519. "bits": [ "1", "1", "1", "0", "0", "0", "0" ],
  169520. "attributes": {
  169521. "hdlname": "cache_I mi_len",
  169522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:37.21-37.27"
  169523. }
  169524. },
  169525. "cache_I.mi_rdata": {
  169526. "hide_name": 0,
  169527. "bits": [ 215, 214, 213, 212, 270, 269, 268, 267, 211, 210, 224, 223, 266, 265, 279, 278, 222, 221, 220, 219, 277, 276, 275, 274, 218, 217, 216, 225, 273, 272, 271, 280 ],
  169528. "attributes": {
  169529. "hdlname": "cache_I mi_rdata",
  169530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:46.21-46.29"
  169531. }
  169532. },
  169533. "cache_I.mi_ready": {
  169534. "hide_name": 0,
  169535. "bits": [ 133 ],
  169536. "attributes": {
  169537. "hdlname": "cache_I mi_ready",
  169538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:40.21-40.29"
  169539. }
  169540. },
  169541. "cache_I.mi_rlast": {
  169542. "hide_name": 0,
  169543. "bits": [ 641 ],
  169544. "attributes": {
  169545. "hdlname": "cache_I mi_rlast",
  169546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:48.21-48.29"
  169547. }
  169548. },
  169549. "cache_I.mi_rlast_SB_LUT4_I1_O": {
  169550. "hide_name": 0,
  169551. "bits": [ 133, 123, 124, 134 ],
  169552. "attributes": {
  169553. "force_downto": "00000000000000000000000000000001",
  169554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169555. }
  169556. },
  169557. "cache_I.mi_rlast_SB_LUT4_I3_O": {
  169558. "hide_name": 0,
  169559. "bits": [ 5491, 5513, 645, 642 ],
  169560. "attributes": {
  169561. "force_downto": "00000000000000000000000000000001",
  169562. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169563. }
  169564. },
  169565. "cache_I.mi_rstb": {
  169566. "hide_name": 0,
  169567. "bits": [ 230 ],
  169568. "attributes": {
  169569. "hdlname": "cache_I mi_rstb",
  169570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:47.21-47.28"
  169571. }
  169572. },
  169573. "cache_I.mi_rstb_SB_LUT4_I0_I2": {
  169574. "hide_name": 0,
  169575. "bits": [ 230, 133, 647, 122 ],
  169576. "attributes": {
  169577. "force_downto": "00000000000000000000000000000001",
  169578. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  169579. }
  169580. },
  169581. "cache_I.mi_wdata": {
  169582. "hide_name": 0,
  169583. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  169584. "attributes": {
  169585. "hdlname": "cache_I mi_wdata",
  169586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:42.21-42.29"
  169587. }
  169588. },
  169589. "cache_I.mi_wlast": {
  169590. "hide_name": 0,
  169591. "bits": [ 120 ],
  169592. "attributes": {
  169593. "hdlname": "cache_I mi_wlast",
  169594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:44.21-44.29"
  169595. }
  169596. },
  169597. "cache_I.mi_wlast_SB_LUT4_I1_I3": {
  169598. "hide_name": 0,
  169599. "bits": [ 650 ],
  169600. "attributes": {
  169601. "abc9_carry": "00000000000000000000000000000001",
  169602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  169603. }
  169604. },
  169605. "cache_I.mi_wlast_SB_LUT4_I1_O": {
  169606. "hide_name": 0,
  169607. "bits": [ 669, 655, 658, 661, 664, 667, 668, 648 ],
  169608. "attributes": {
  169609. "force_downto": "00000000000000000000000000000001",
  169610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  169611. }
  169612. },
  169613. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_1_I3": {
  169614. "hide_name": 0,
  169615. "bits": [ 657 ],
  169616. "attributes": {
  169617. "abc9_carry": "00000000000000000000000000000001",
  169618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  169619. }
  169620. },
  169621. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_2_I3": {
  169622. "hide_name": 0,
  169623. "bits": [ 660 ],
  169624. "attributes": {
  169625. "abc9_carry": "00000000000000000000000000000001",
  169626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  169627. }
  169628. },
  169629. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_3_I3": {
  169630. "hide_name": 0,
  169631. "bits": [ 663 ],
  169632. "attributes": {
  169633. "abc9_carry": "00000000000000000000000000000001",
  169634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  169635. }
  169636. },
  169637. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_4_I3": {
  169638. "hide_name": 0,
  169639. "bits": [ 666 ],
  169640. "attributes": {
  169641. "abc9_carry": "00000000000000000000000000000001",
  169642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  169643. }
  169644. },
  169645. "cache_I.mi_wlast_SB_LUT4_I1_O_SB_LUT4_O_5_I3": {
  169646. "hide_name": 0,
  169647. "bits": [ 651 ],
  169648. "attributes": {
  169649. "abc9_carry": "00000000000000000000000000000001",
  169650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:510.16-510.28|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  169651. }
  169652. },
  169653. "cache_I.req_addr": {
  169654. "hide_name": 0,
  169655. "bits": [ 208, 207, 206, 152, 153, 154, 155, 156, 157, 158, 159, 160, 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169656. "attributes": {
  169657. "hdlname": "cache_I req_addr",
  169658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:110.14-110.22"
  169659. }
  169660. },
  169661. "cache_I.req_addr_idx": {
  169662. "hide_name": 0,
  169663. "bits": [ 152, 153, 154, 155, 156, 157, 158, 159, 160 ],
  169664. "attributes": {
  169665. "hdlname": "cache_I req_addr_idx",
  169666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:112.14-112.26"
  169667. }
  169668. },
  169669. "cache_I.req_addr_ofs": {
  169670. "hide_name": 0,
  169671. "bits": [ 208, 207, 206 ],
  169672. "attributes": {
  169673. "hdlname": "cache_I req_addr_ofs",
  169674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:113.14-113.26"
  169675. }
  169676. },
  169677. "cache_I.req_addr_pre": {
  169678. "hide_name": 0,
  169679. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41, 396, 397, 398, 399, 673, 672, 681, 680, 679, 678, 677, 676, 675, 674, 671, 670 ],
  169680. "attributes": {
  169681. "hdlname": "cache_I req_addr_pre",
  169682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:22.21-22.33"
  169683. }
  169684. },
  169685. "cache_I.req_addr_pre_idx": {
  169686. "hide_name": 0,
  169687. "bits": [ 37, 38, 39, 40, 41, 396, 397, 398, 399 ],
  169688. "attributes": {
  169689. "hdlname": "cache_I req_addr_pre_idx",
  169690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:108.14-108.30"
  169691. }
  169692. },
  169693. "cache_I.req_addr_tag": {
  169694. "hide_name": 0,
  169695. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169696. "attributes": {
  169697. "hdlname": "cache_I req_addr_tag",
  169698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:111.14-111.26"
  169699. }
  169700. },
  169701. "cache_I.req_wdata": {
  169702. "hide_name": 0,
  169703. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  169704. "attributes": {
  169705. "hdlname": "cache_I req_wdata",
  169706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:27.21-27.30"
  169707. }
  169708. },
  169709. "cache_I.resp_rdata": {
  169710. "hide_name": 0,
  169711. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  169712. "attributes": {
  169713. "hdlname": "cache_I resp_rdata",
  169714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:33.21-33.31"
  169715. }
  169716. },
  169717. "cache_I.rst": {
  169718. "hide_name": 0,
  169719. "bits": [ 127 ],
  169720. "attributes": {
  169721. "hdlname": "cache_I rst",
  169722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:52.14-52.17"
  169723. }
  169724. },
  169725. "cache_I.tag_next.w": {
  169726. "hide_name": 0,
  169727. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  169728. "signed": 1,
  169729. "attributes": {
  169730. "hdlname": "cache_I tag_next.w",
  169731. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:443.11-443.12"
  169732. }
  169733. },
  169734. "cache_I.way_age[0]": {
  169735. "hide_name": 0,
  169736. "bits": [ 433, 438 ],
  169737. "attributes": {
  169738. "hdlname": "cache_I way_age[0]",
  169739. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:118.14-118.21"
  169740. }
  169741. },
  169742. "cache_I.way_age[1]": {
  169743. "hide_name": 0,
  169744. "bits": [ 385, 384 ],
  169745. "attributes": {
  169746. "hdlname": "cache_I way_age[1]",
  169747. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:118.14-118.21"
  169748. }
  169749. },
  169750. "cache_I.way_age[2]": {
  169751. "hide_name": 0,
  169752. "bits": [ 391, 390 ],
  169753. "attributes": {
  169754. "hdlname": "cache_I way_age[2]",
  169755. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:118.14-118.21"
  169756. }
  169757. },
  169758. "cache_I.way_age[3]": {
  169759. "hide_name": 0,
  169760. "bits": [ 382, 380 ],
  169761. "attributes": {
  169762. "hdlname": "cache_I way_age[3]",
  169763. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:118.14-118.21"
  169764. }
  169765. },
  169766. "cache_I.way_age_nxt[0]": {
  169767. "hide_name": 0,
  169768. "bits": [ 455, 452 ],
  169769. "attributes": {
  169770. "hdlname": "cache_I way_age_nxt[0]",
  169771. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:127.14-127.25"
  169772. }
  169773. },
  169774. "cache_I.way_age_nxt[1]": {
  169775. "hide_name": 0,
  169776. "bits": [ 515, 512 ],
  169777. "attributes": {
  169778. "hdlname": "cache_I way_age_nxt[1]",
  169779. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:127.14-127.25"
  169780. }
  169781. },
  169782. "cache_I.way_age_nxt[2]": {
  169783. "hide_name": 0,
  169784. "bits": [ 554, 551 ],
  169785. "attributes": {
  169786. "hdlname": "cache_I way_age_nxt[2]",
  169787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:127.14-127.25"
  169788. }
  169789. },
  169790. "cache_I.way_age_nxt[3]": {
  169791. "hide_name": 0,
  169792. "bits": [ 595, 592 ],
  169793. "attributes": {
  169794. "hdlname": "cache_I way_age_nxt[3]",
  169795. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:127.14-127.25"
  169796. }
  169797. },
  169798. "cache_I.way_age_we": {
  169799. "hide_name": 0,
  169800. "bits": [ "1" ],
  169801. "attributes": {
  169802. "hdlname": "cache_I way_age_we",
  169803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:128.14-128.24"
  169804. }
  169805. },
  169806. "cache_I.way_dirty[0]": {
  169807. "hide_name": 0,
  169808. "bits": [ 139 ],
  169809. "attributes": {
  169810. "hdlname": "cache_I way_dirty[0]",
  169811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:117.14-117.23"
  169812. }
  169813. },
  169814. "cache_I.way_dirty[1]": {
  169815. "hide_name": 0,
  169816. "bits": [ 145 ],
  169817. "attributes": {
  169818. "hdlname": "cache_I way_dirty[1]",
  169819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:117.14-117.23"
  169820. }
  169821. },
  169822. "cache_I.way_dirty[2]": {
  169823. "hide_name": 0,
  169824. "bits": [ 146 ],
  169825. "attributes": {
  169826. "hdlname": "cache_I way_dirty[2]",
  169827. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:117.14-117.23"
  169828. }
  169829. },
  169830. "cache_I.way_dirty[3]": {
  169831. "hide_name": 0,
  169832. "bits": [ 143 ],
  169833. "attributes": {
  169834. "hdlname": "cache_I way_dirty[3]",
  169835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:117.14-117.23"
  169836. }
  169837. },
  169838. "cache_I.way_dirty_nxt[0]": {
  169839. "hide_name": 0,
  169840. "bits": [ 125 ],
  169841. "attributes": {
  169842. "hdlname": "cache_I way_dirty_nxt[0]",
  169843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:124.14-124.27"
  169844. }
  169845. },
  169846. "cache_I.way_dirty_nxt[1]": {
  169847. "hide_name": 0,
  169848. "bits": [ 125 ],
  169849. "attributes": {
  169850. "hdlname": "cache_I way_dirty_nxt[1]",
  169851. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:124.14-124.27"
  169852. }
  169853. },
  169854. "cache_I.way_dirty_nxt[2]": {
  169855. "hide_name": 0,
  169856. "bits": [ 125 ],
  169857. "attributes": {
  169858. "hdlname": "cache_I way_dirty_nxt[2]",
  169859. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:124.14-124.27"
  169860. }
  169861. },
  169862. "cache_I.way_dirty_nxt[3]": {
  169863. "hide_name": 0,
  169864. "bits": [ 125 ],
  169865. "attributes": {
  169866. "hdlname": "cache_I way_dirty_nxt[3]",
  169867. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:124.14-124.27"
  169868. }
  169869. },
  169870. "cache_I.way_tag[0]": {
  169871. "hide_name": 0,
  169872. "bits": [ 300, 387, 302, 310, 319, 326, 330, 339, 346, 352, 360, 291 ],
  169873. "attributes": {
  169874. "hdlname": "cache_I way_tag[0]",
  169875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:119.14-119.21"
  169876. }
  169877. },
  169878. "cache_I.way_tag[1]": {
  169879. "hide_name": 0,
  169880. "bits": [ 298, 281, 304, 306, 317, 324, 333, 338, 345, 353, 359, 293 ],
  169881. "attributes": {
  169882. "hdlname": "cache_I way_tag[1]",
  169883. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:119.14-119.21"
  169884. }
  169885. },
  169886. "cache_I.way_tag[2]": {
  169887. "hide_name": 0,
  169888. "bits": [ 299, 388, 305, 311, 316, 325, 332, 337, 344, 354, 358, 294 ],
  169889. "attributes": {
  169890. "hdlname": "cache_I way_tag[2]",
  169891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:119.14-119.21"
  169892. }
  169893. },
  169894. "cache_I.way_tag[3]": {
  169895. "hide_name": 0,
  169896. "bits": [ 301, 389, 303, 312, 318, 323, 331, 340, 347, 351, 361, 292 ],
  169897. "attributes": {
  169898. "hdlname": "cache_I way_tag[3]",
  169899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:119.14-119.21"
  169900. }
  169901. },
  169902. "cache_I.way_tag_nxt": {
  169903. "hide_name": 0,
  169904. "bits": [ 479, 478, 477, 476, 475, 474, 485, 484, 483, 482, 481, 480 ],
  169905. "attributes": {
  169906. "hdlname": "cache_I way_tag_nxt",
  169907. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:130.14-130.25"
  169908. }
  169909. },
  169910. "cache_I.way_valid[0]": {
  169911. "hide_name": 0,
  169912. "bits": [ 378 ],
  169913. "attributes": {
  169914. "hdlname": "cache_I way_valid[0]",
  169915. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:116.14-116.23"
  169916. }
  169917. },
  169918. "cache_I.way_valid[1]": {
  169919. "hide_name": 0,
  169920. "bits": [ 379 ],
  169921. "attributes": {
  169922. "hdlname": "cache_I way_valid[1]",
  169923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:116.14-116.23"
  169924. }
  169925. },
  169926. "cache_I.way_valid[2]": {
  169927. "hide_name": 0,
  169928. "bits": [ 374 ],
  169929. "attributes": {
  169930. "hdlname": "cache_I way_valid[2]",
  169931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:116.14-116.23"
  169932. }
  169933. },
  169934. "cache_I.way_valid[3]": {
  169935. "hide_name": 0,
  169936. "bits": [ 381 ],
  169937. "attributes": {
  169938. "hdlname": "cache_I way_valid[3]",
  169939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:116.14-116.23"
  169940. }
  169941. },
  169942. "cache_I.way_valid_nxt[0]": {
  169943. "hide_name": 0,
  169944. "bits": [ 121 ],
  169945. "attributes": {
  169946. "hdlname": "cache_I way_valid_nxt[0]",
  169947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:121.14-121.27"
  169948. }
  169949. },
  169950. "cache_I.way_valid_nxt[1]": {
  169951. "hide_name": 0,
  169952. "bits": [ 121 ],
  169953. "attributes": {
  169954. "hdlname": "cache_I way_valid_nxt[1]",
  169955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:121.14-121.27"
  169956. }
  169957. },
  169958. "cache_I.way_valid_nxt[2]": {
  169959. "hide_name": 0,
  169960. "bits": [ 121 ],
  169961. "attributes": {
  169962. "hdlname": "cache_I way_valid_nxt[2]",
  169963. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:121.14-121.27"
  169964. }
  169965. },
  169966. "cache_I.way_valid_nxt[3]": {
  169967. "hide_name": 0,
  169968. "bits": [ 121 ],
  169969. "attributes": {
  169970. "hdlname": "cache_I way_valid_nxt[3]",
  169971. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_core.v:121.14-121.27"
  169972. }
  169973. },
  169974. "cache_bus_I.addr_mux": {
  169975. "hide_name": 0,
  169976. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41, 396, 397, 398, 399, 673, 672, 681, 680, 679, 678, 677, 676, 675, 674, 671, 670, "x", "x", "x", "x", "x", "x" ],
  169977. "attributes": {
  169978. "hdlname": "cache_bus_I addr_mux",
  169979. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:110.14-110.22"
  169980. }
  169981. },
  169982. "cache_bus_I.clk": {
  169983. "hide_name": 0,
  169984. "bits": [ 42 ],
  169985. "attributes": {
  169986. "hdlname": "cache_bus_I clk",
  169987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:77.14-77.17"
  169988. }
  169989. },
  169990. "cache_bus_I.ctrl_is_cache": {
  169991. "hide_name": 0,
  169992. "bits": [ 734 ],
  169993. "attributes": {
  169994. "hdlname": "cache_bus_I ctrl_is_cache",
  169995. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:99.7-99.20"
  169996. }
  169997. },
  169998. "cache_bus_I.ctrl_is_cache_SB_DFFE_Q_D": {
  169999. "hide_name": 0,
  170000. "bits": [ 732 ],
  170001. "attributes": {
  170002. }
  170003. },
  170004. "cache_bus_I.ctrl_is_dbus": {
  170005. "hide_name": 0,
  170006. "bits": [ 702 ],
  170007. "attributes": {
  170008. "hdlname": "cache_bus_I ctrl_is_dbus",
  170009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:98.7-98.19"
  170010. }
  170011. },
  170012. "cache_bus_I.ctrl_is_dbus_SB_DFFE_Q_D": {
  170013. "hide_name": 0,
  170014. "bits": [ 739 ],
  170015. "attributes": {
  170016. }
  170017. },
  170018. "cache_bus_I.ctrl_is_dbus_SB_LUT4_I2_O": {
  170019. "hide_name": 0,
  170020. "bits": [ 730, 731, 684 ],
  170021. "attributes": {
  170022. "force_downto": "00000000000000000000000000000001",
  170023. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170024. }
  170025. },
  170026. "cache_bus_I.ctrl_is_ibus": {
  170027. "hide_name": 0,
  170028. "bits": [ 741 ],
  170029. "attributes": {
  170030. "hdlname": "cache_bus_I ctrl_is_ibus",
  170031. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:97.7-97.19"
  170032. }
  170033. },
  170034. "cache_bus_I.ctrl_is_io": {
  170035. "hide_name": 0,
  170036. "bits": [ 742 ],
  170037. "attributes": {
  170038. "hdlname": "cache_bus_I ctrl_is_io",
  170039. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:101.7-101.17"
  170040. }
  170041. },
  170042. "cache_bus_I.ctrl_is_ram": {
  170043. "hide_name": 0,
  170044. "bits": [ 744 ],
  170045. "attributes": {
  170046. "hdlname": "cache_bus_I ctrl_is_ram",
  170047. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:100.7-100.18"
  170048. }
  170049. },
  170050. "cache_bus_I.ctrl_is_ram_SB_DFFE_Q_D": {
  170051. "hide_name": 0,
  170052. "bits": [ 743 ],
  170053. "attributes": {
  170054. }
  170055. },
  170056. "cache_bus_I.d_wb_adr": {
  170057. "hide_name": 0,
  170058. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730, 687, 689, 894, 893, "x", "x", 736, 735 ],
  170059. "attributes": {
  170060. "hdlname": "cache_bus_I d_wb_adr",
  170061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:37.21-37.29"
  170062. }
  170063. },
  170064. "cache_bus_I.d_wb_bte": {
  170065. "hide_name": 0,
  170066. "bits": [ "0", "0" ],
  170067. "attributes": {
  170068. "hdlname": "cache_bus_I d_wb_bte",
  170069. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:42.21-42.29"
  170070. }
  170071. },
  170072. "cache_bus_I.d_wb_cti": {
  170073. "hide_name": 0,
  170074. "bits": [ "0", "0", "0" ],
  170075. "attributes": {
  170076. "hdlname": "cache_bus_I d_wb_cti",
  170077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:43.21-43.29"
  170078. }
  170079. },
  170080. "cache_bus_I.d_wb_dat_miso": {
  170081. "hide_name": 0,
  170082. "bits": [ 822, 786, 840, 831, 828, 825, 816, 783, 750, 747, 819, 813, 810, 807, 804, 801, 798, 795, 792, 789, 780, 777, 774, 771, 768, 765, 762, 759, 756, 753, 837, 834 ],
  170083. "attributes": {
  170084. "hdlname": "cache_bus_I d_wb_dat_miso",
  170085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:38.21-38.34"
  170086. }
  170087. },
  170088. "cache_bus_I.d_wb_dat_mosi": {
  170089. "hide_name": 0,
  170090. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  170091. "attributes": {
  170092. "hdlname": "cache_bus_I d_wb_dat_mosi",
  170093. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:39.21-39.34"
  170094. }
  170095. },
  170096. "cache_bus_I.d_wb_err": {
  170097. "hide_name": 0,
  170098. "bits": [ "0" ],
  170099. "attributes": {
  170100. "hdlname": "cache_bus_I d_wb_err",
  170101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:41.21-41.29"
  170102. }
  170103. },
  170104. "cache_bus_I.d_wb_we": {
  170105. "hide_name": 0,
  170106. "bits": [ 469 ],
  170107. "attributes": {
  170108. "hdlname": "cache_bus_I d_wb_we",
  170109. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:36.21-36.28"
  170110. }
  170111. },
  170112. "cache_bus_I.i_axi_ar_payload_addr": {
  170113. "hide_name": 0,
  170114. "bits": [ "0", "0", "0", "0", "0", 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  170115. "attributes": {
  170116. "hdlname": "cache_bus_I i_axi_ar_payload_addr",
  170117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:22.21-22.42"
  170118. }
  170119. },
  170120. "cache_bus_I.i_axi_ar_payload_burst": {
  170121. "hide_name": 0,
  170122. "bits": [ "1", "0" ],
  170123. "attributes": {
  170124. "hdlname": "cache_bus_I i_axi_ar_payload_burst",
  170125. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:24.21-24.43"
  170126. }
  170127. },
  170128. "cache_bus_I.i_axi_ar_payload_cache": {
  170129. "hide_name": 0,
  170130. "bits": [ "1", "1", "1", "1" ],
  170131. "attributes": {
  170132. "hdlname": "cache_bus_I i_axi_ar_payload_cache",
  170133. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:25.21-25.43"
  170134. }
  170135. },
  170136. "cache_bus_I.i_axi_ar_payload_len": {
  170137. "hide_name": 0,
  170138. "bits": [ "1", "1", "1", "0", "0", "0", "0", "0" ],
  170139. "attributes": {
  170140. "hdlname": "cache_bus_I i_axi_ar_payload_len",
  170141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:23.21-23.41"
  170142. }
  170143. },
  170144. "cache_bus_I.i_axi_ar_payload_prot": {
  170145. "hide_name": 0,
  170146. "bits": [ "0", "1", "1" ],
  170147. "attributes": {
  170148. "hdlname": "cache_bus_I i_axi_ar_payload_prot",
  170149. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:26.21-26.42"
  170150. }
  170151. },
  170152. "cache_bus_I.i_axi_ar_valid": {
  170153. "hide_name": 0,
  170154. "bits": [ 738 ],
  170155. "attributes": {
  170156. "hdlname": "cache_bus_I i_axi_ar_valid",
  170157. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:20.21-20.35"
  170158. }
  170159. },
  170160. "cache_bus_I.i_axi_r_payload_data": {
  170161. "hide_name": 0,
  170162. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  170163. "attributes": {
  170164. "hdlname": "cache_bus_I i_axi_r_payload_data",
  170165. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:29.21-29.41"
  170166. }
  170167. },
  170168. "cache_bus_I.i_axi_r_payload_last": {
  170169. "hide_name": 0,
  170170. "bits": [ "0" ],
  170171. "attributes": {
  170172. "hdlname": "cache_bus_I i_axi_r_payload_last",
  170173. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:31.21-31.41"
  170174. }
  170175. },
  170176. "cache_bus_I.i_axi_r_payload_resp": {
  170177. "hide_name": 0,
  170178. "bits": [ "0", "0" ],
  170179. "attributes": {
  170180. "hdlname": "cache_bus_I i_axi_r_payload_resp",
  170181. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:30.21-30.41"
  170182. }
  170183. },
  170184. "cache_bus_I.i_axi_r_ready": {
  170185. "hide_name": 0,
  170186. "bits": [ "1" ],
  170187. "attributes": {
  170188. "hdlname": "cache_bus_I i_axi_r_ready",
  170189. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:28.21-28.34"
  170190. }
  170191. },
  170192. "cache_bus_I.i_axi_r_valid": {
  170193. "hide_name": 0,
  170194. "bits": [ 843 ],
  170195. "attributes": {
  170196. "hdlname": "cache_bus_I i_axi_r_valid",
  170197. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:27.21-27.34"
  170198. }
  170199. },
  170200. "cache_bus_I.ib_addr_cnt": {
  170201. "hide_name": 0,
  170202. "bits": [ 848, 847, 846 ],
  170203. "attributes": {
  170204. "hdlname": "cache_bus_I ib_addr_cnt",
  170205. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:114.13-114.24"
  170206. }
  170207. },
  170208. "cache_bus_I.ib_addr_lsb": {
  170209. "hide_name": 0,
  170210. "bits": [ 707, 705, 703 ],
  170211. "attributes": {
  170212. "hdlname": "cache_bus_I ib_addr_lsb",
  170213. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:115.13-115.24"
  170214. }
  170215. },
  170216. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_1_I2": {
  170217. "hide_name": 0,
  170218. "bits": [ 733, 848, 851, "0" ],
  170219. "attributes": {
  170220. "force_downto": "00000000000000000000000000000001",
  170221. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170222. }
  170223. },
  170224. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_2_I3": {
  170225. "hide_name": 0,
  170226. "bits": [ 855 ],
  170227. "attributes": {
  170228. "abc9_carry": "00000000000000000000000000000001",
  170229. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  170230. }
  170231. },
  170232. "cache_bus_I.ib_addr_lsb_SB_LUT4_O_I3": {
  170233. "hide_name": 0,
  170234. "bits": [ 850 ],
  170235. "attributes": {
  170236. "abc9_carry": "00000000000000000000000000000001",
  170237. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:224.54-224.103|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  170238. }
  170239. },
  170240. "cache_bus_I.ram_addr": {
  170241. "hide_name": 0,
  170242. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41, 396, 397, 398, 399, 673, 672, 681, 680, 679, 678, 677, 676, 675, 674, 671, 670, "x", "x", "x", "x" ],
  170243. "attributes": {
  170244. "hdlname": "cache_bus_I ram_addr",
  170245. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:55.21-55.29"
  170246. }
  170247. },
  170248. "cache_bus_I.ram_rdata": {
  170249. "hide_name": 0,
  170250. "bits": [ 43, 51, 47, 55, 45, 53, 49, 57, 44, 52, 48, 56, 46, 54, 50, 58, 78, 86, 82, 90, 80, 88, 84, 92, 79, 87, 83, 91, 81, 89, 85, 93 ],
  170251. "attributes": {
  170252. "hdlname": "cache_bus_I ram_rdata",
  170253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:58.21-58.30"
  170254. }
  170255. },
  170256. "cache_bus_I.ram_wdata": {
  170257. "hide_name": 0,
  170258. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  170259. "attributes": {
  170260. "hdlname": "cache_bus_I ram_wdata",
  170261. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:56.21-56.30"
  170262. }
  170263. },
  170264. "cache_bus_I.rdata_io": {
  170265. "hide_name": 0,
  170266. "bits": [ 820, 784, 838, 829, 826, 823, 814, 781, 748, 745, 817, 811, 808, 805, 802, 799, 796, 793, 790, 787, 778, 775, 772, 769, 766, 763, 760, 757, 754, 751, 835, 832 ],
  170267. "attributes": {
  170268. "hdlname": "cache_bus_I rdata_io",
  170269. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:104.14-104.22"
  170270. }
  170271. },
  170272. "cache_bus_I.rdata_io_SB_DFF_Q_D": {
  170273. "hide_name": 0,
  170274. "bits": [ 881, 880, 878, 877, 876, 875, 874, 873, 872, 871, 870, 869, 879, 868, 857, 856 ],
  170275. "attributes": {
  170276. }
  170277. },
  170278. "cache_bus_I.rdata_mux_d": {
  170279. "hide_name": 0,
  170280. "bits": [ 822, 786, 840, 831, 828, 825, 816, 783, 750, 747, 819, 813, 810, 807, 804, 801, 798, 795, 792, 789, 780, 777, 774, 771, 768, 765, 762, 759, 756, 753, 837, 834 ],
  170281. "attributes": {
  170282. "hdlname": "cache_bus_I rdata_mux_d",
  170283. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:106.14-106.25"
  170284. }
  170285. },
  170286. "cache_bus_I.rdata_mux_i": {
  170287. "hide_name": 0,
  170288. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  170289. "attributes": {
  170290. "hdlname": "cache_bus_I rdata_mux_i",
  170291. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:105.14-105.25"
  170292. }
  170293. },
  170294. "cache_bus_I.rdata_sel": {
  170295. "hide_name": 0,
  170296. "bits": [ 744, 742 ],
  170297. "attributes": {
  170298. "hdlname": "cache_bus_I rdata_sel",
  170299. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:107.14-107.23"
  170300. }
  170301. },
  170302. "cache_bus_I.req_addr_pre": {
  170303. "hide_name": 0,
  170304. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41, 396, 397, 398, 399, 673, 672, 681, 680, 679, 678, 677, 676, 675, 674, 671, 670, "x", "x", "x", "x" ],
  170305. "attributes": {
  170306. "hdlname": "cache_bus_I req_addr_pre",
  170307. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:63.21-63.33"
  170308. }
  170309. },
  170310. "cache_bus_I.req_new": {
  170311. "hide_name": 0,
  170312. "bits": [ 889 ],
  170313. "attributes": {
  170314. "hdlname": "cache_bus_I req_new",
  170315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:119.6-119.13"
  170316. }
  170317. },
  170318. "cache_bus_I.req_new_SB_DFF_Q_D": {
  170319. "hide_name": 0,
  170320. "bits": [ 888 ],
  170321. "attributes": {
  170322. }
  170323. },
  170324. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2": {
  170325. "hide_name": 0,
  170326. "bits": [ 893, 894, 733, 891 ],
  170327. "attributes": {
  170328. "force_downto": "00000000000000000000000000000001",
  170329. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170330. }
  170331. },
  170332. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_I3_O": {
  170333. "hide_name": 0,
  170334. "bits": [ 890, 892, 895 ],
  170335. "attributes": {
  170336. "force_downto": "00000000000000000000000000000001",
  170337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170338. }
  170339. },
  170340. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  170341. "hide_name": 0,
  170342. "bits": [ 127, 903 ],
  170343. "attributes": {
  170344. "force_downto": "00000000000000000000000000000001",
  170345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170346. }
  170347. },
  170348. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_I3_I2": {
  170349. "hide_name": 0,
  170350. "bits": [ 852, 906, 907, 903 ],
  170351. "attributes": {
  170352. "force_downto": "00000000000000000000000000000001",
  170353. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170354. }
  170355. },
  170356. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_I3_O": {
  170357. "hide_name": 0,
  170358. "bits": [ 900, 901, 902 ],
  170359. "attributes": {
  170360. "force_downto": "00000000000000000000000000000001",
  170361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170362. }
  170363. },
  170364. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  170365. "hide_name": 0,
  170366. "bits": [ 903, 904, 905 ],
  170367. "attributes": {
  170368. "force_downto": "00000000000000000000000000000001",
  170369. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170370. }
  170371. },
  170372. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  170373. "hide_name": 0,
  170374. "bits": [ 853, 909, 908 ],
  170375. "attributes": {
  170376. "force_downto": "00000000000000000000000000000001",
  170377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170378. }
  170379. },
  170380. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  170381. "hide_name": 0,
  170382. "bits": [ 852, 733, 740, 908 ],
  170383. "attributes": {
  170384. "force_downto": "00000000000000000000000000000001",
  170385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170386. }
  170387. },
  170388. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  170389. "hide_name": 0,
  170390. "bits": [ 906, 854, 638, 910 ],
  170391. "attributes": {
  170392. "force_downto": "00000000000000000000000000000001",
  170393. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170394. }
  170395. },
  170396. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  170397. "hide_name": 0,
  170398. "bits": [ 896, 897, 898, 899 ],
  170399. "attributes": {
  170400. "force_downto": "00000000000000000000000000000001",
  170401. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170402. }
  170403. },
  170404. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  170405. "hide_name": 0,
  170406. "bits": [ 470, 638, 911, 912 ],
  170407. "attributes": {
  170408. "force_downto": "00000000000000000000000000000001",
  170409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170410. }
  170411. },
  170412. "cache_bus_I.req_new_SB_DFF_Q_D_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  170413. "hide_name": 0,
  170414. "bits": [ 913, 914, 915 ],
  170415. "attributes": {
  170416. "force_downto": "00000000000000000000000000000001",
  170417. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170418. }
  170419. },
  170420. "cache_bus_I.req_new_SB_LUT4_I1_I3": {
  170421. "hide_name": 0,
  170422. "bits": [ 845, 889, 734, 917 ],
  170423. "attributes": {
  170424. "force_downto": "00000000000000000000000000000001",
  170425. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170426. }
  170427. },
  170428. "cache_bus_I.req_new_SB_LUT4_I1_I3_SB_DFFR_Q_D": {
  170429. "hide_name": 0,
  170430. "bits": [ 918 ],
  170431. "attributes": {
  170432. }
  170433. },
  170434. "cache_bus_I.req_new_SB_LUT4_I1_O": {
  170435. "hide_name": 0,
  170436. "bits": [ 135, 232 ],
  170437. "attributes": {
  170438. "force_downto": "00000000000000000000000000000001",
  170439. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170440. }
  170441. },
  170442. "cache_bus_I.req_new_SB_LUT4_I1_O_SB_LUT4_O_I3": {
  170443. "hide_name": 0,
  170444. "bits": [ 204, 121, 136 ],
  170445. "attributes": {
  170446. "force_downto": "00000000000000000000000000000001",
  170447. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170448. }
  170449. },
  170450. "cache_bus_I.req_wdata": {
  170451. "hide_name": 0,
  170452. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  170453. "attributes": {
  170454. "hdlname": "cache_bus_I req_wdata",
  170455. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:68.21-68.30"
  170456. }
  170457. },
  170458. "cache_bus_I.resp_rdata": {
  170459. "hide_name": 0,
  170460. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  170461. "attributes": {
  170462. "hdlname": "cache_bus_I resp_rdata",
  170463. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:74.21-74.31"
  170464. }
  170465. },
  170466. "cache_bus_I.rst": {
  170467. "hide_name": 0,
  170468. "bits": [ 127 ],
  170469. "attributes": {
  170470. "hdlname": "cache_bus_I rst",
  170471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:78.14-78.17"
  170472. }
  170473. },
  170474. "cache_bus_I.state": {
  170475. "hide_name": 0,
  170476. "bits": [ 733, 906, 914, 913, 470, 845, 916 ],
  170477. "attributes": {
  170478. "onehot": "00000000000000000000000000000001"
  170479. }
  170480. },
  170481. "cache_bus_I.state_SB_DFF_Q_2_D": {
  170482. "hide_name": 0,
  170483. "bits": [ 921, 920, 919 ],
  170484. "attributes": {
  170485. "force_downto": "00000000000000000000000000000001",
  170486. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170487. }
  170488. },
  170489. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O": {
  170490. "hide_name": 0,
  170491. "bits": [ 922, 924, 923 ],
  170492. "attributes": {
  170493. }
  170494. },
  170495. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_I1_O_SB_DFF_D_Q": {
  170496. "hide_name": 0,
  170497. "bits": [ 854, 853, 852 ],
  170498. "attributes": {
  170499. "force_downto": "00000000000000000000000000000001",
  170500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:0.0-0.0|/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:143.3-171.10|/usr/bin/../share/yosys/techmap.v:569.20-569.21"
  170501. }
  170502. },
  170503. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1": {
  170504. "hide_name": 0,
  170505. "bits": [ 906, 928, 931 ],
  170506. "attributes": {
  170507. "force_downto": "00000000000000000000000000000001",
  170508. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170509. }
  170510. },
  170511. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_I2_O": {
  170512. "hide_name": 0,
  170513. "bits": [ 925, 927, 920 ],
  170514. "attributes": {
  170515. "force_downto": "00000000000000000000000000000001",
  170516. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170517. }
  170518. },
  170519. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I1_SB_LUT4_I2_O_SB_LUT4_O_I2": {
  170520. "hide_name": 0,
  170521. "bits": [ 127, 932, 897 ],
  170522. "attributes": {
  170523. "force_downto": "00000000000000000000000000000001",
  170524. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170525. }
  170526. },
  170527. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I2": {
  170528. "hide_name": 0,
  170529. "bits": [ 853, 740, 929, 898 ],
  170530. "attributes": {
  170531. "force_downto": "00000000000000000000000000000001",
  170532. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170533. }
  170534. },
  170535. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3": {
  170536. "hide_name": 0,
  170537. "bits": [ 735, 736, 740, 930 ],
  170538. "attributes": {
  170539. "force_downto": "00000000000000000000000000000001",
  170540. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170541. }
  170542. },
  170543. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  170544. "hide_name": 0,
  170545. "bits": [ 925, 926, 919 ],
  170546. "attributes": {
  170547. "force_downto": "00000000000000000000000000000001",
  170548. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170549. }
  170550. },
  170551. "cache_bus_I.state_SB_DFF_Q_2_D_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  170552. "hide_name": 0,
  170553. "bits": [ 127, 933 ],
  170554. "attributes": {
  170555. "force_downto": "00000000000000000000000000000001",
  170556. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170557. }
  170558. },
  170559. "cache_bus_I.state_SB_DFF_Q_6_D": {
  170560. "hide_name": 0,
  170561. "bits": [ 934, 927, 926, 925, 921, 920, 919 ],
  170562. "attributes": {
  170563. }
  170564. },
  170565. "cache_bus_I.state_SB_DFF_Q_6_D_SB_LUT4_O_I3": {
  170566. "hide_name": 0,
  170567. "bits": [ 740, 930, 935 ],
  170568. "attributes": {
  170569. "force_downto": "00000000000000000000000000000001",
  170570. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170571. }
  170572. },
  170573. "cache_bus_I.state_SB_DFF_Q_6_D_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  170574. "hide_name": 0,
  170575. "bits": [ 845, 734, 849 ],
  170576. "attributes": {
  170577. "force_downto": "00000000000000000000000000000001",
  170578. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170579. }
  170580. },
  170581. "cache_bus_I.state_SB_DFF_Q_6_D_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  170582. "hide_name": 0,
  170583. "bits": [ 845, 734, 849, 936 ],
  170584. "attributes": {
  170585. "force_downto": "00000000000000000000000000000001",
  170586. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170587. }
  170588. },
  170589. "cache_bus_I.wb_ack": {
  170590. "hide_name": 0,
  170591. "bits": [ 5415, 5980, 5979, 5966 ],
  170592. "attributes": {
  170593. "hdlname": "cache_bus_I wb_ack",
  170594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:52.21-52.27"
  170595. }
  170596. },
  170597. "cache_bus_I.wb_ack_i": {
  170598. "hide_name": 0,
  170599. "bits": [ 939 ],
  170600. "attributes": {
  170601. "hdlname": "cache_bus_I wb_ack_i",
  170602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:123.7-123.15"
  170603. }
  170604. },
  170605. "cache_bus_I.wb_ack_i_SB_DFF_Q_D": {
  170606. "hide_name": 0,
  170607. "bits": [ 938 ],
  170608. "attributes": {
  170609. }
  170610. },
  170611. "cache_bus_I.wb_ack_i_SB_LUT4_I2_O": {
  170612. "hide_name": 0,
  170613. "bits": [ 469, 914, 740, 937 ],
  170614. "attributes": {
  170615. "force_downto": "00000000000000000000000000000001",
  170616. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170617. }
  170618. },
  170619. "cache_bus_I.wb_ack_i_SB_LUT4_I2_O_SB_DFFR_Q_D": {
  170620. "hide_name": 0,
  170621. "bits": [ 940 ],
  170622. "attributes": {
  170623. }
  170624. },
  170625. "cache_bus_I.wb_ack_i_SB_LUT4_I2_O_SB_LUT4_I3_O": {
  170626. "hide_name": 0,
  170627. "bits": [ 942 ],
  170628. "attributes": {
  170629. }
  170630. },
  170631. "cache_bus_I.wb_ack_i_SB_LUT4_I3_O": {
  170632. "hide_name": 0,
  170633. "bits": [ 735, 740, 911, 898 ],
  170634. "attributes": {
  170635. "force_downto": "00000000000000000000000000000001",
  170636. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170637. }
  170638. },
  170639. "cache_bus_I.wb_addr": {
  170640. "hide_name": 0,
  170641. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730 ],
  170642. "attributes": {
  170643. "hdlname": "cache_bus_I wb_addr",
  170644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:46.21-46.28"
  170645. }
  170646. },
  170647. "cache_bus_I.wb_cyc": {
  170648. "hide_name": 0,
  170649. "bits": [ 5631, 6887, 6450, 5966 ],
  170650. "attributes": {
  170651. "hdlname": "cache_bus_I wb_cyc",
  170652. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:50.21-50.27"
  170653. }
  170654. },
  170655. "cache_bus_I.wb_rdata": {
  170656. "hide_name": 0,
  170657. "bits": [ 5659, 5658, 5656, 5648, 5655, 5654, 5647, 5645, 5644, 5643, 5653, 5652, 5642, 5651, 5650, 5649, 5641, 5640, 5639, 5638, 5637, 5636, 5665, 5664, 5663, 5662, 5661, 5660, 5657, 5646, 5635, 5634, 6935, 6936, 6937, 6938, 6939, 6940, 6941, 6942, 6943, 6944, 6945, 6946, 6947, 6948, 6949, 6950, 6951, 6952, 6953, 6954, 6955, 6956, 6957, 6958, 6959, 6960, 6961, 6962, 6963, 6964, 6965, 6966, 6469, 6468, 6467, 6466, 6465, 6463, 6477, 6476, 6474, 6473, 6472, 6471, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 6470, 6462, 6454, 6254, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  170658. "attributes": {
  170659. "hdlname": "cache_bus_I wb_rdata",
  170660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:49.21-49.29",
  170661. "unused_bits": "32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63"
  170662. }
  170663. },
  170664. "cache_bus_I.wb_wdata": {
  170665. "hide_name": 0,
  170666. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  170667. "attributes": {
  170668. "hdlname": "cache_bus_I wb_wdata",
  170669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:47.21-47.29"
  170670. }
  170671. },
  170672. "cache_bus_I.wb_we": {
  170673. "hide_name": 0,
  170674. "bits": [ 469 ],
  170675. "attributes": {
  170676. "hdlname": "cache_bus_I wb_we",
  170677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2memcache//rtl/mc_bus_vex.v:51.21-51.26"
  170678. }
  170679. },
  170680. "cache_req_addr_pre": {
  170681. "hide_name": 0,
  170682. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41, 396, 397, 398, 399, 673, 672, 681, 680, 679, 678, 677, 676, 675, 674, 671, 670, "x", "x", "x", "x" ],
  170683. "attributes": {
  170684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:94.14-94.32"
  170685. }
  170686. },
  170687. "cache_req_wdata": {
  170688. "hide_name": 0,
  170689. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  170690. "attributes": {
  170691. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:97.14-97.29"
  170692. }
  170693. },
  170694. "cache_resp_rdata": {
  170695. "hide_name": 0,
  170696. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  170697. "attributes": {
  170698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:102.14-102.30"
  170699. }
  170700. },
  170701. "clk_1x": {
  170702. "hide_name": 0,
  170703. "bits": [ 42 ],
  170704. "attributes": {
  170705. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:139.7-139.13"
  170706. }
  170707. },
  170708. "clk_4x": {
  170709. "hide_name": 0,
  170710. "bits": [ 5666 ],
  170711. "attributes": {
  170712. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:140.7-140.13"
  170713. }
  170714. },
  170715. "clk_in": {
  170716. "hide_name": 0,
  170717. "bits": [ 31 ],
  170718. "attributes": {
  170719. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:38.14-38.20"
  170720. }
  170721. },
  170722. "cpu_I.BranchPlugin_jumpInterface_payload": {
  170723. "hide_name": 0,
  170724. "bits": [ "0", "x", 1459, 1454, 1444, 1420, 1411, 1401, 1390, 1373, 1430, 1817, 1920, 1935, 1942, 1949, 1956, 1963, 1970, 1977, 1984, 1852, 1860, 1867, 1874, 1881, 1888, 1895, 1902, 1909, 1916, 1931 ],
  170725. "attributes": {
  170726. "hdlname": "cpu_I BranchPlugin_jumpInterface_payload",
  170727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:943.23-943.57"
  170728. }
  170729. },
  170730. "cpu_I.CsrPlugin_allowException": {
  170731. "hide_name": 0,
  170732. "bits": [ "1" ],
  170733. "attributes": {
  170734. "hdlname": "cpu_I CsrPlugin_allowException",
  170735. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:960.23-960.47"
  170736. }
  170737. },
  170738. "cpu_I.CsrPlugin_allowInterrupts": {
  170739. "hide_name": 0,
  170740. "bits": [ "1" ],
  170741. "attributes": {
  170742. "hdlname": "cpu_I CsrPlugin_allowInterrupts",
  170743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:959.23-959.48"
  170744. }
  170745. },
  170746. "cpu_I.CsrPlugin_exception": {
  170747. "hide_name": 0,
  170748. "bits": [ 1008 ],
  170749. "attributes": {
  170750. "hdlname": "cpu_I CsrPlugin_exception",
  170751. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1180.23-1180.42"
  170752. }
  170753. },
  170754. "cpu_I.CsrPlugin_exceptionPendings_0": {
  170755. "hide_name": 0,
  170756. "bits": [ "0" ],
  170757. "attributes": {
  170758. "hdlname": "cpu_I CsrPlugin_exceptionPendings_0",
  170759. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:948.23-948.52"
  170760. }
  170761. },
  170762. "cpu_I.CsrPlugin_exceptionPendings_3": {
  170763. "hide_name": 0,
  170764. "bits": [ 1008 ],
  170765. "attributes": {
  170766. "hdlname": "cpu_I CsrPlugin_exceptionPendings_3",
  170767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:951.23-951.52"
  170768. }
  170769. },
  170770. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr": {
  170771. "hide_name": 0,
  170772. "bits": [ 995, 993, 989, 987, 985, 983, 981, 979, 977, 975, 973, 971, 967, 965, 963, 961, 959, 957, 955, 953, 951, 949, 1007, 1005, 1003, 1001, 999, 997, 991, 969, 947, 945 ],
  170773. "attributes": {
  170774. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionContext_badAddr",
  170775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1174.23-1174.75"
  170776. }
  170777. },
  170778. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionContext_code": {
  170779. "hide_name": 0,
  170780. "bits": [ "1", "1", "0", "1" ],
  170781. "attributes": {
  170782. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionContext_code",
  170783. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1173.23-1173.72"
  170784. }
  170785. },
  170786. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionTargetPrivilege": {
  170787. "hide_name": 0,
  170788. "bits": [ "1", "1" ],
  170789. "attributes": {
  170790. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionTargetPrivilege",
  170791. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1176.23-1176.75"
  170792. }
  170793. },
  170794. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionTargetPrivilegeUncapped": {
  170795. "hide_name": 0,
  170796. "bits": [ "1", "1" ],
  170797. "attributes": {
  170798. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionTargetPrivilegeUncapped",
  170799. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1175.23-1175.83"
  170800. }
  170801. },
  170802. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_decode": {
  170803. "hide_name": 0,
  170804. "bits": [ "0" ],
  170805. "attributes": {
  170806. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_decode",
  170807. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1169.23-1169.77"
  170808. }
  170809. },
  170810. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack": {
  170811. "hide_name": 0,
  170812. "bits": [ 1008 ],
  170813. "attributes": {
  170814. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack",
  170815. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1172.23-1172.80"
  170816. }
  170817. },
  170818. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q": {
  170819. "hide_name": 0,
  170820. "bits": [ 1154, 1009, 1011, 1013 ],
  170821. "attributes": {
  170822. "force_downto": "00000000000000000000000000000001",
  170823. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170824. }
  170825. },
  170826. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D": {
  170827. "hide_name": 0,
  170828. "bits": [ 1010 ],
  170829. "attributes": {
  170830. }
  170831. },
  170832. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I2": {
  170833. "hide_name": 0,
  170834. "bits": [ 1014, 1017, 1018, 1015 ],
  170835. "attributes": {
  170836. "force_downto": "00000000000000000000000000000001",
  170837. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170838. }
  170839. },
  170840. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I2_SB_DFFR_Q_D": {
  170841. "hide_name": 0,
  170842. "bits": [ 1016 ],
  170843. "attributes": {
  170844. }
  170845. },
  170846. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I3": {
  170847. "hide_name": 0,
  170848. "bits": [ 1017, 1020, 1015 ],
  170849. "attributes": {
  170850. "force_downto": "00000000000000000000000000000001",
  170851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170852. }
  170853. },
  170854. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_D_Q_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_DFFR_Q_D": {
  170855. "hide_name": 0,
  170856. "bits": [ 1019 ],
  170857. "attributes": {
  170858. }
  170859. },
  170860. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_DFFR_Q_D": {
  170861. "hide_name": 0,
  170862. "bits": [ 1021 ],
  170863. "attributes": {
  170864. }
  170865. },
  170866. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValidsRegs_writeBack_SB_LUT4_I3_O": {
  170867. "hide_name": 0,
  170868. "bits": [ 1026 ],
  170869. "attributes": {
  170870. }
  170871. },
  170872. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValids_decode": {
  170873. "hide_name": 0,
  170874. "bits": [ "0" ],
  170875. "attributes": {
  170876. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionValids_decode",
  170877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1165.23-1165.73"
  170878. }
  170879. },
  170880. "cpu_I.CsrPlugin_exceptionPortCtrl_exceptionValids_writeBack": {
  170881. "hide_name": 0,
  170882. "bits": [ 1008 ],
  170883. "attributes": {
  170884. "hdlname": "cpu_I CsrPlugin_exceptionPortCtrl_exceptionValids_writeBack",
  170885. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1168.23-1168.76"
  170886. }
  170887. },
  170888. "cpu_I.CsrPlugin_forceMachineWire": {
  170889. "hide_name": 0,
  170890. "bits": [ "0" ],
  170891. "attributes": {
  170892. "hdlname": "cpu_I CsrPlugin_forceMachineWire",
  170893. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:955.23-955.49"
  170894. }
  170895. },
  170896. "cpu_I.CsrPlugin_inWfi": {
  170897. "hide_name": 0,
  170898. "bits": [ "0" ],
  170899. "attributes": {
  170900. "hdlname": "cpu_I CsrPlugin_inWfi",
  170901. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:944.23-944.38"
  170902. }
  170903. },
  170904. "cpu_I.CsrPlugin_interrupt_code": {
  170905. "hide_name": 0,
  170906. "bits": [ "1", "1", "0", "0" ],
  170907. "attributes": {
  170908. "hdlname": "cpu_I CsrPlugin_interrupt_code",
  170909. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1178.23-1178.47"
  170910. }
  170911. },
  170912. "cpu_I.CsrPlugin_interrupt_targetPrivilege": {
  170913. "hide_name": 0,
  170914. "bits": [ "1", "1" ],
  170915. "attributes": {
  170916. "hdlname": "cpu_I CsrPlugin_interrupt_targetPrivilege",
  170917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1179.23-1179.58"
  170918. }
  170919. },
  170920. "cpu_I.CsrPlugin_jumpInterface_payload": {
  170921. "hide_name": 0,
  170922. "bits": [ "x", "x", 6967, 6968, 6969, 6970, 6971, 6972, 6973, 6974, 6975, 6976, 6977, 6978, 6979, 6980, 6981, 6982, 6983, 6984, 6985, 6986, 6987, 6988, 6989, 6990, 6991, 6992, 6993, 6994, 6995, 6996 ],
  170923. "attributes": {
  170924. "hdlname": "cpu_I CsrPlugin_jumpInterface_payload",
  170925. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:947.23-947.54",
  170926. "unused_bits": "2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31"
  170927. }
  170928. },
  170929. "cpu_I.CsrPlugin_lastStageWasWfi": {
  170930. "hide_name": 0,
  170931. "bits": [ "0" ],
  170932. "attributes": {
  170933. "hdlname": "cpu_I CsrPlugin_lastStageWasWfi",
  170934. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1181.23-1181.48"
  170935. }
  170936. },
  170937. "cpu_I.CsrPlugin_mcause_exceptionCode": {
  170938. "hide_name": 0,
  170939. "bits": [ "1", "1", "0", 1028 ],
  170940. "attributes": {
  170941. "hdlname": "cpu_I CsrPlugin_mcause_exceptionCode",
  170942. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1158.23-1158.53"
  170943. }
  170944. },
  170945. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_DFF_Q_D": {
  170946. "hide_name": 0,
  170947. "bits": [ 1027 ],
  170948. "attributes": {
  170949. }
  170950. },
  170951. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_I2": {
  170952. "hide_name": 0,
  170953. "bits": [ 1028, 1029, 1030, 1031 ],
  170954. "attributes": {
  170955. "force_downto": "00000000000000000000000000000001",
  170956. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170957. }
  170958. },
  170959. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_I2_SB_LUT4_O_1_I3": {
  170960. "hide_name": 0,
  170961. "bits": [ 1037, 1038 ],
  170962. "attributes": {
  170963. "force_downto": "00000000000000000000000000000001",
  170964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170965. }
  170966. },
  170967. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O": {
  170968. "hide_name": 0,
  170969. "bits": [ 1126, 1128, 1045, 1032 ],
  170970. "attributes": {
  170971. "force_downto": "00000000000000000000000000000001",
  170972. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170973. }
  170974. },
  170975. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3": {
  170976. "hide_name": 0,
  170977. "bits": [ 1041, 1042, 1043, 1044 ],
  170978. "attributes": {
  170979. "force_downto": "00000000000000000000000000000001",
  170980. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170981. }
  170982. },
  170983. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_DFFR_Q_D": {
  170984. "hide_name": 0,
  170985. "bits": [ 1046 ],
  170986. "attributes": {
  170987. }
  170988. },
  170989. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_DFFR_Q_D_SB_LUT4_O_I2": {
  170990. "hide_name": 0,
  170991. "bits": [ 1047, 1048, 1039 ],
  170992. "attributes": {
  170993. "force_downto": "00000000000000000000000000000001",
  170994. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  170995. }
  170996. },
  170997. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I1_O": {
  170998. "hide_name": 0,
  170999. "bits": [ 1050, 1047, 1054, 1053 ],
  171000. "attributes": {
  171001. "force_downto": "00000000000000000000000000000001",
  171002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171003. }
  171004. },
  171005. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I2_O": {
  171006. "hide_name": 0,
  171007. "bits": [ 1049, 1009, 1050, 1051 ],
  171008. "attributes": {
  171009. "force_downto": "00000000000000000000000000000001",
  171010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171011. }
  171012. },
  171013. "cpu_I.CsrPlugin_mcause_exceptionCode_SB_LUT4_I0_O_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_DFFR_Q_D": {
  171014. "hide_name": 0,
  171015. "bits": [ 1055 ],
  171016. "attributes": {
  171017. }
  171018. },
  171019. "cpu_I.CsrPlugin_mcause_interrupt": {
  171020. "hide_name": 0,
  171021. "bits": [ 1057 ],
  171022. "attributes": {
  171023. "hdlname": "cpu_I CsrPlugin_mcause_interrupt",
  171024. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1157.23-1157.49"
  171025. }
  171026. },
  171027. "cpu_I.CsrPlugin_mcause_interrupt_SB_DFF_Q_D": {
  171028. "hide_name": 0,
  171029. "bits": [ 1056 ],
  171030. "attributes": {
  171031. }
  171032. },
  171033. "cpu_I.CsrPlugin_mcause_interrupt_SB_LUT4_I1_I3": {
  171034. "hide_name": 0,
  171035. "bits": [ 1009, 1025 ],
  171036. "attributes": {
  171037. "force_downto": "00000000000000000000000000000001",
  171038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171039. }
  171040. },
  171041. "cpu_I.CsrPlugin_mcause_interrupt_SB_LUT4_I2_O": {
  171042. "hide_name": 0,
  171043. "bits": [ 1037, 1060, 1058, 1063 ],
  171044. "attributes": {
  171045. "force_downto": "00000000000000000000000000000001",
  171046. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171047. }
  171048. },
  171049. "cpu_I.CsrPlugin_mepc": {
  171050. "hide_name": 0,
  171051. "bits": [ 1113, 1111, 1107, 1041, 1104, 1102, 1100, 1098, 1096, 1094, 1092, 1090, 1086, 1084, 1082, 1080, 1078, 1076, 1074, 1072, 1070, 1068, 1125, 1123, 1121, 1119, 1117, 1115, 1109, 1088, 1066, 1062 ],
  171052. "attributes": {
  171053. "hdlname": "cpu_I CsrPlugin_mepc",
  171054. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1147.23-1147.37"
  171055. }
  171056. },
  171057. "cpu_I.CsrPlugin_mip_MEIP": {
  171058. "hide_name": 0,
  171059. "bits": [ "0" ],
  171060. "attributes": {
  171061. "hdlname": "cpu_I CsrPlugin_mip_MEIP",
  171062. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1151.23-1151.41"
  171063. }
  171064. },
  171065. "cpu_I.CsrPlugin_mip_MSIP": {
  171066. "hide_name": 0,
  171067. "bits": [ 1126 ],
  171068. "attributes": {
  171069. "hdlname": "cpu_I CsrPlugin_mip_MSIP",
  171070. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1153.23-1153.41"
  171071. }
  171072. },
  171073. "cpu_I.CsrPlugin_mip_MSIP_SB_DFFSR_Q_R": {
  171074. "hide_name": 0,
  171075. "bits": [ 1127 ],
  171076. "attributes": {
  171077. }
  171078. },
  171079. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2": {
  171080. "hide_name": 0,
  171081. "bits": [ 1033, 1034, 1035, 1036 ],
  171082. "attributes": {
  171083. "force_downto": "00000000000000000000000000000001",
  171084. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171085. }
  171086. },
  171087. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_DFFR_Q_D": {
  171088. "hide_name": 0,
  171089. "bits": [ 1131 ],
  171090. "attributes": {
  171091. }
  171092. },
  171093. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2": {
  171094. "hide_name": 0,
  171095. "bits": [ 1036, 1132, 1039 ],
  171096. "attributes": {
  171097. "force_downto": "00000000000000000000000000000001",
  171098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171099. }
  171100. },
  171101. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1": {
  171102. "hide_name": 0,
  171103. "bits": [ 1090, 1035, 1043, 1135 ],
  171104. "attributes": {
  171105. "force_downto": "00000000000000000000000000000001",
  171106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171107. }
  171108. },
  171109. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O": {
  171110. "hide_name": 0,
  171111. "bits": [ 1037, 1139, 1138, 1142 ],
  171112. "attributes": {
  171113. "force_downto": "00000000000000000000000000000001",
  171114. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171115. }
  171116. },
  171117. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  171118. "hide_name": 0,
  171119. "bits": [ 1140, 1042, 1034, 1141 ],
  171120. "attributes": {
  171121. "force_downto": "00000000000000000000000000000001",
  171122. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171123. }
  171124. },
  171125. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q_D": {
  171126. "hide_name": 0,
  171127. "bits": [ 1143, 1144 ],
  171128. "attributes": {
  171129. }
  171130. },
  171131. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_DFFS_Q_D_SB_DFFS_D_Q": {
  171132. "hide_name": 0,
  171133. "bits": [ 1145, 1052 ],
  171134. "attributes": {
  171135. "force_downto": "00000000000000000000000000000001",
  171136. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171137. }
  171138. },
  171139. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_I1_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_O": {
  171140. "hide_name": 0,
  171141. "bits": [ 1050, 1047, 1136, 1148 ],
  171142. "attributes": {
  171143. "force_downto": "00000000000000000000000000000001",
  171144. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171145. }
  171146. },
  171147. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_1_O": {
  171148. "hide_name": 0,
  171149. "bits": [ 1137 ],
  171150. "attributes": {
  171151. }
  171152. },
  171153. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O": {
  171154. "hide_name": 0,
  171155. "bits": [ 1134 ],
  171156. "attributes": {
  171157. }
  171158. },
  171159. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O_SB_DFFR_D_Q": {
  171160. "hide_name": 0,
  171161. "bits": [ 1035, 1133, 1150, 1152 ],
  171162. "attributes": {
  171163. "force_downto": "00000000000000000000000000000001",
  171164. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171165. }
  171166. },
  171167. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_I2_SB_LUT4_I1_I2_SB_LUT4_I2_O_SB_DFFR_D_Q_SB_LUT4_O_1_I3": {
  171168. "hide_name": 0,
  171169. "bits": [ 1098, 1037, 1043, 1151 ],
  171170. "attributes": {
  171171. "force_downto": "00000000000000000000000000000001",
  171172. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171173. }
  171174. },
  171175. "cpu_I.CsrPlugin_mip_MSIP_SB_LUT4_I1_O": {
  171176. "hide_name": 0,
  171177. "bits": [ 1130 ],
  171178. "attributes": {
  171179. }
  171180. },
  171181. "cpu_I.CsrPlugin_mip_MTIP": {
  171182. "hide_name": 0,
  171183. "bits": [ "0" ],
  171184. "attributes": {
  171185. "hdlname": "cpu_I CsrPlugin_mip_MTIP",
  171186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1152.23-1152.41"
  171187. }
  171188. },
  171189. "cpu_I.CsrPlugin_misa_base": {
  171190. "hide_name": 0,
  171191. "bits": [ "1", "0" ],
  171192. "attributes": {
  171193. "hdlname": "cpu_I CsrPlugin_misa_base",
  171194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1143.23-1143.42"
  171195. }
  171196. },
  171197. "cpu_I.CsrPlugin_misa_extensions": {
  171198. "hide_name": 0,
  171199. "bits": [ "0", "1", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  171200. "attributes": {
  171201. "hdlname": "cpu_I CsrPlugin_misa_extensions",
  171202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1144.23-1144.48"
  171203. }
  171204. },
  171205. "cpu_I.CsrPlugin_mtval": {
  171206. "hide_name": 0,
  171207. "bits": [ 1176, 1175, 1173, 1033, 1172, 1171, 1170, 1149, 1169, 1168, 1167, 1140, 1165, 1164, 1163, 1162, 1161, 1160, 1159, 1158, 1157, 1156, 1182, 1181, 1180, 1179, 1178, 1177, 1174, 1166, 1155, 1061 ],
  171208. "attributes": {
  171209. "hdlname": "cpu_I CsrPlugin_mtval",
  171210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1159.23-1159.38"
  171211. }
  171212. },
  171213. "cpu_I.CsrPlugin_mtvec_base": {
  171214. "hide_name": 0,
  171215. "bits": [ 1224, 1222, 1221, 1219, 1217, 1215, 1214, 1212, 1210, 1208, 1205, 1204, 1202, 1200, 1198, 1196, 1194, 1192, 1190, 1188, 1238, 1236, 1234, 1232, 1230, 1228, 1226, 1207, 1186, 1184 ],
  171216. "attributes": {
  171217. "hdlname": "cpu_I CsrPlugin_mtvec_base",
  171218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1146.23-1146.43"
  171219. }
  171220. },
  171221. "cpu_I.CsrPlugin_privilege": {
  171222. "hide_name": 0,
  171223. "bits": [ "1", "1" ],
  171224. "attributes": {
  171225. "hdlname": "cpu_I CsrPlugin_privilege",
  171226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:954.23-954.42"
  171227. }
  171228. },
  171229. "cpu_I.CsrPlugin_selfException_payload_badAddr": {
  171230. "hide_name": 0,
  171231. "bits": [ 994, 992, 988, 986, 984, 982, 980, 978, 976, 974, 972, 970, 966, 964, 962, 960, 958, 956, 954, 952, 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  171232. "attributes": {
  171233. "hdlname": "cpu_I CsrPlugin_selfException_payload_badAddr",
  171234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:958.23-958.62"
  171235. }
  171236. },
  171237. "cpu_I.CsrPlugin_selfException_payload_code": {
  171238. "hide_name": 0,
  171239. "bits": [ "1", "1", "0", "1" ],
  171240. "attributes": {
  171241. "hdlname": "cpu_I CsrPlugin_selfException_payload_code",
  171242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:957.23-957.59"
  171243. }
  171244. },
  171245. "cpu_I.CsrPlugin_selfException_valid": {
  171246. "hide_name": 0,
  171247. "bits": [ 944 ],
  171248. "attributes": {
  171249. "hdlname": "cpu_I CsrPlugin_selfException_valid",
  171250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:956.23-956.52"
  171251. }
  171252. },
  171253. "cpu_I.CsrPlugin_targetPrivilege": {
  171254. "hide_name": 0,
  171255. "bits": [ "1", "1" ],
  171256. "attributes": {
  171257. "hdlname": "cpu_I CsrPlugin_targetPrivilege",
  171258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1189.23-1189.48"
  171259. }
  171260. },
  171261. "cpu_I.CsrPlugin_thirdPartyWake": {
  171262. "hide_name": 0,
  171263. "bits": [ "0" ],
  171264. "attributes": {
  171265. "hdlname": "cpu_I CsrPlugin_thirdPartyWake",
  171266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:945.23-945.47"
  171267. }
  171268. },
  171269. "cpu_I.CsrPlugin_xtvec_base": {
  171270. "hide_name": 0,
  171271. "bits": [ 1224, 1222, 1221, 1219, 1217, 1215, 1214, 1212, 1210, 1208, 1205, 1204, 1202, 1200, 1198, 1196, 1194, 1192, 1190, 1188, 1238, 1236, 1234, 1232, 1230, 1228, 1226, 1207, 1186, 1184 ],
  171272. "attributes": {
  171273. "hdlname": "cpu_I CsrPlugin_xtvec_base",
  171274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1192.23-1192.43"
  171275. }
  171276. },
  171277. "cpu_I.DBusSimplePlugin_memoryExceptionPort_payload_badAddr": {
  171278. "hide_name": 0,
  171279. "bits": [ 3180, 3235, 3197, 3274, 3158, 3227, 3242, 3247, 3185, 3252, 3240, 3257, 3262, 3267, 3272, 3089, 3100, 3105, 3112, 3119, 3126, 3223, 3133, 3216, 3140, 3147, 3154, 3168, 3209, 3204, 3190, 3173 ],
  171280. "attributes": {
  171281. "hdlname": "cpu_I DBusSimplePlugin_memoryExceptionPort_payload_badAddr",
  171282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:927.23-927.75"
  171283. }
  171284. },
  171285. "cpu_I.DBusSimplePlugin_memoryExceptionPort_payload_code": {
  171286. "hide_name": 0,
  171287. "bits": [ "x", "x", "x", "x" ],
  171288. "attributes": {
  171289. "hdlname": "cpu_I DBusSimplePlugin_memoryExceptionPort_payload_code",
  171290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:926.23-926.72"
  171291. }
  171292. },
  171293. "cpu_I.DBusSimplePlugin_memoryExceptionPort_valid": {
  171294. "hide_name": 0,
  171295. "bits": [ "0" ],
  171296. "attributes": {
  171297. "hdlname": "cpu_I DBusSimplePlugin_memoryExceptionPort_valid",
  171298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:925.23-925.65"
  171299. }
  171300. },
  171301. "cpu_I.DBusSimplePlugin_mmuBus_busy": {
  171302. "hide_name": 0,
  171303. "bits": [ "0" ],
  171304. "attributes": {
  171305. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_busy",
  171306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:939.23-939.51"
  171307. }
  171308. },
  171309. "cpu_I.DBusSimplePlugin_mmuBus_cmd_bypassTranslation": {
  171310. "hide_name": 0,
  171311. "bits": [ "0" ],
  171312. "attributes": {
  171313. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_cmd_bypassTranslation",
  171314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:930.23-930.68"
  171315. }
  171316. },
  171317. "cpu_I.DBusSimplePlugin_mmuBus_cmd_virtualAddress": {
  171318. "hide_name": 0,
  171319. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  171320. "attributes": {
  171321. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_cmd_virtualAddress",
  171322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:929.23-929.65",
  171323. "unused_bits": "28 29"
  171324. }
  171325. },
  171326. "cpu_I.DBusSimplePlugin_mmuBus_rsp_allowExecute": {
  171327. "hide_name": 0,
  171328. "bits": [ "1" ],
  171329. "attributes": {
  171330. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_allowExecute",
  171331. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:935.23-935.63"
  171332. }
  171333. },
  171334. "cpu_I.DBusSimplePlugin_mmuBus_rsp_allowRead": {
  171335. "hide_name": 0,
  171336. "bits": [ "1" ],
  171337. "attributes": {
  171338. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_allowRead",
  171339. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:933.23-933.60"
  171340. }
  171341. },
  171342. "cpu_I.DBusSimplePlugin_mmuBus_rsp_allowWrite": {
  171343. "hide_name": 0,
  171344. "bits": [ "1" ],
  171345. "attributes": {
  171346. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_allowWrite",
  171347. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:934.23-934.61"
  171348. }
  171349. },
  171350. "cpu_I.DBusSimplePlugin_mmuBus_rsp_exception": {
  171351. "hide_name": 0,
  171352. "bits": [ "0" ],
  171353. "attributes": {
  171354. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_exception",
  171355. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:936.23-936.60"
  171356. }
  171357. },
  171358. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess": {
  171359. "hide_name": 0,
  171360. "bits": [ 1244 ],
  171361. "attributes": {
  171362. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_isIoAccess",
  171363. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:932.23-932.61"
  171364. }
  171365. },
  171366. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_I2": {
  171367. "hide_name": 0,
  171368. "bits": [ 1242, 1243, 1244 ],
  171369. "attributes": {
  171370. "force_downto": "00000000000000000000000000000001",
  171371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171372. }
  171373. },
  171374. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_I2_SB_LUT4_O_I2": {
  171375. "hide_name": 0,
  171376. "bits": [ 1246, 1247, 1248, 1249 ],
  171377. "attributes": {
  171378. "force_downto": "00000000000000000000000000000001",
  171379. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171380. }
  171381. },
  171382. "cpu_I.DBusSimplePlugin_mmuBus_rsp_isIoAccess_SB_LUT4_I3_O": {
  171383. "hide_name": 0,
  171384. "bits": [ 2858, 1253, 1245 ],
  171385. "attributes": {
  171386. "force_downto": "00000000000000000000000000000001",
  171387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171388. }
  171389. },
  171390. "cpu_I.DBusSimplePlugin_mmuBus_rsp_physicalAddress": {
  171391. "hide_name": 0,
  171392. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  171393. "attributes": {
  171394. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_physicalAddress",
  171395. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:931.23-931.66",
  171396. "unused_bits": "28 29"
  171397. }
  171398. },
  171399. "cpu_I.DBusSimplePlugin_mmuBus_rsp_refilling": {
  171400. "hide_name": 0,
  171401. "bits": [ "0" ],
  171402. "attributes": {
  171403. "hdlname": "cpu_I DBusSimplePlugin_mmuBus_rsp_refilling",
  171404. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:937.23-937.60"
  171405. }
  171406. },
  171407. "cpu_I.DBusSimplePlugin_redoBranch_payload": {
  171408. "hide_name": 0,
  171409. "bits": [ "0", "0", 5080, 5079, 5078, 5077, 5076, 5075, 5074, 5073, 5072, 5071, 5069, 5068, 5067, 5066, 5065, 5064, 5063, 5062, 5061, 5060, 5087, 5086, 5085, 5084, 5083, 5082, 5081, 5070, 5059, 5058 ],
  171410. "attributes": {
  171411. "hdlname": "cpu_I DBusSimplePlugin_redoBranch_payload",
  171412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:941.23-941.58"
  171413. }
  171414. },
  171415. "cpu_I.DBusSimplePlugin_redoBranch_valid": {
  171416. "hide_name": 0,
  171417. "bits": [ "0" ],
  171418. "attributes": {
  171419. "hdlname": "cpu_I DBusSimplePlugin_redoBranch_valid",
  171420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:940.23-940.56"
  171421. }
  171422. },
  171423. "cpu_I.IBusCachedPlugin_cache._zz_10_": {
  171424. "hide_name": 0,
  171425. "bits": [ 6999, "x", 7000, 7001, 7002, 7003, 7004, 7005, 7006, 7007, 7008, 7009, 7010, 7011, 7012, 7013, 7014, 7015, 7016, 7017, 7018, 7019, 7020 ],
  171426. "attributes": {
  171427. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_10_",
  171428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:92.23-92.30",
  171429. "unused_bits": "0 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22"
  171430. }
  171431. },
  171432. "cpu_I.IBusCachedPlugin_cache._zz_11_": {
  171433. "hide_name": 0,
  171434. "bits": [ 1334, 1259, 1262, 1295, 1328, 1337, 1340, 1343, 1346, 1349, 1352, 1265, 1268, 1271, 1274, 1331, 1325, 1322, 1319, 1316, 1313, 1310, 1307, 1304, 1301, 1277, 1280, 1283, 1286, 1289, 1292, 1298 ],
  171435. "attributes": {
  171436. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_11_",
  171437. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:93.23-93.30"
  171438. }
  171439. },
  171440. "cpu_I.IBusCachedPlugin_cache._zz_14_": {
  171441. "hide_name": 0,
  171442. "bits": [ 6999 ],
  171443. "attributes": {
  171444. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_14_",
  171445. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:96.23-96.30",
  171446. "unused_bits": "0 "
  171447. }
  171448. },
  171449. "cpu_I.IBusCachedPlugin_cache._zz_15_": {
  171450. "hide_name": 0,
  171451. "bits": [ "x" ],
  171452. "attributes": {
  171453. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_15_",
  171454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:97.23-97.30"
  171455. }
  171456. },
  171457. "cpu_I.IBusCachedPlugin_cache._zz_16_": {
  171458. "hide_name": 0,
  171459. "bits": [ 1353, "0", 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  171460. "attributes": {
  171461. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_16_",
  171462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:98.23-98.30"
  171463. }
  171464. },
  171465. "cpu_I.IBusCachedPlugin_cache._zz_1_": {
  171466. "hide_name": 0,
  171467. "bits": [ 843 ],
  171468. "attributes": {
  171469. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_1_",
  171470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:99.23-99.29"
  171471. }
  171472. },
  171473. "cpu_I.IBusCachedPlugin_cache._zz_2_": {
  171474. "hide_name": 0,
  171475. "bits": [ 1599 ],
  171476. "attributes": {
  171477. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_2_",
  171478. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:100.23-100.29"
  171479. }
  171480. },
  171481. "cpu_I.IBusCachedPlugin_cache._zz_3_": {
  171482. "hide_name": 0,
  171483. "bits": [ 1354 ],
  171484. "attributes": {
  171485. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_3_",
  171486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:107.23-107.29"
  171487. }
  171488. },
  171489. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O": {
  171490. "hide_name": 0,
  171491. "bits": [ 1356, 1358, 842, 1355 ],
  171492. "attributes": {
  171493. "force_downto": "00000000000000000000000000000001",
  171494. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171495. }
  171496. },
  171497. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFS_Q_D": {
  171498. "hide_name": 0,
  171499. "bits": [ 1357 ],
  171500. "attributes": {
  171501. }
  171502. },
  171503. "cpu_I.IBusCachedPlugin_cache._zz_3__SB_LUT4_I0_O_SB_DFFS_Q_D_SB_LUT4_O_I3": {
  171504. "hide_name": 0,
  171505. "bits": [ 1360, 1361, 1023, 1478 ],
  171506. "attributes": {
  171507. "force_downto": "00000000000000000000000000000001",
  171508. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171509. }
  171510. },
  171511. "cpu_I.IBusCachedPlugin_cache._zz_4_": {
  171512. "hide_name": 0,
  171513. "bits": [ "1" ],
  171514. "attributes": {
  171515. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_4_",
  171516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:122.23-122.29"
  171517. }
  171518. },
  171519. "cpu_I.IBusCachedPlugin_cache._zz_5_": {
  171520. "hide_name": 0,
  171521. "bits": [ 1419, 1410, 1400, 1387, 1372, 1369 ],
  171522. "attributes": {
  171523. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_5_",
  171524. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:123.23-123.29"
  171525. }
  171526. },
  171527. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3": {
  171528. "hide_name": 0,
  171529. "bits": [ 1370, 1367, 1371 ],
  171530. "attributes": {
  171531. "force_downto": "00000000000000000000000000000001",
  171532. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171533. }
  171534. },
  171535. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1": {
  171536. "hide_name": 0,
  171537. "bits": [ 1373, 1374, 1375, 1376 ],
  171538. "attributes": {
  171539. "force_downto": "00000000000000000000000000000001",
  171540. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171541. }
  171542. },
  171543. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2": {
  171544. "hide_name": 0,
  171545. "bits": [ 1377, 1378, 1379, 1380 ],
  171546. "attributes": {
  171547. "force_downto": "00000000000000000000000000000001",
  171548. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171549. }
  171550. },
  171551. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_1_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  171552. "hide_name": 0,
  171553. "bits": [ 1382 ],
  171554. "attributes": {
  171555. "abc9_carry": "00000000000000000000000000000001",
  171556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171557. }
  171558. },
  171559. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3": {
  171560. "hide_name": 0,
  171561. "bits": [ 1385, 1367, 1386 ],
  171562. "attributes": {
  171563. "force_downto": "00000000000000000000000000000001",
  171564. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171565. }
  171566. },
  171567. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1": {
  171568. "hide_name": 0,
  171569. "bits": [ 1388, 1380, 1389 ],
  171570. "attributes": {
  171571. "force_downto": "00000000000000000000000000000001",
  171572. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171573. }
  171574. },
  171575. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3": {
  171576. "hide_name": 0,
  171577. "bits": [ 1394, 1378, 1395 ],
  171578. "attributes": {
  171579. "force_downto": "00000000000000000000000000000001",
  171580. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171581. }
  171582. },
  171583. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  171584. "hide_name": 0,
  171585. "bits": [ 1383 ],
  171586. "attributes": {
  171587. "abc9_carry": "00000000000000000000000000000001",
  171588. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171589. }
  171590. },
  171591. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_I2": {
  171592. "hide_name": 0,
  171593. "bits": [ 1390, 1391, 1392, 1393 ],
  171594. "attributes": {
  171595. "force_downto": "00000000000000000000000000000001",
  171596. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171597. }
  171598. },
  171599. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3": {
  171600. "hide_name": 0,
  171601. "bits": [ 1398, 1367, 1399 ],
  171602. "attributes": {
  171603. "force_downto": "00000000000000000000000000000001",
  171604. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171605. }
  171606. },
  171607. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1": {
  171608. "hide_name": 0,
  171609. "bits": [ 1401, 1402, 1375, 1403 ],
  171610. "attributes": {
  171611. "force_downto": "00000000000000000000000000000001",
  171612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171613. }
  171614. },
  171615. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2": {
  171616. "hide_name": 0,
  171617. "bits": [ 1404, 1378, 1405, 1380 ],
  171618. "attributes": {
  171619. "force_downto": "00000000000000000000000000000001",
  171620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171621. }
  171622. },
  171623. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_3_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  171624. "hide_name": 0,
  171625. "bits": [ 1396 ],
  171626. "attributes": {
  171627. "abc9_carry": "00000000000000000000000000000001",
  171628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171629. }
  171630. },
  171631. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3": {
  171632. "hide_name": 0,
  171633. "bits": [ 1408, 1367, 1409 ],
  171634. "attributes": {
  171635. "force_downto": "00000000000000000000000000000001",
  171636. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171637. }
  171638. },
  171639. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O_I1": {
  171640. "hide_name": 0,
  171641. "bits": [ 1411, 1412, 1375, 1413 ],
  171642. "attributes": {
  171643. "force_downto": "00000000000000000000000000000001",
  171644. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171645. }
  171646. },
  171647. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2": {
  171648. "hide_name": 0,
  171649. "bits": [ 1414, 1378, 1415, 1380 ],
  171650. "attributes": {
  171651. "force_downto": "00000000000000000000000000000001",
  171652. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171653. }
  171654. },
  171655. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_4_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  171656. "hide_name": 0,
  171657. "bits": [ 1406 ],
  171658. "attributes": {
  171659. "abc9_carry": "00000000000000000000000000000001",
  171660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171661. }
  171662. },
  171663. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2": {
  171664. "hide_name": 0,
  171665. "bits": [ 1416, 1367, 1417, 1418 ],
  171666. "attributes": {
  171667. "force_downto": "00000000000000000000000000000001",
  171668. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171669. }
  171670. },
  171671. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_1_I2": {
  171672. "hide_name": 0,
  171673. "bits": [ 1422, 1378, 1423, 1380 ],
  171674. "attributes": {
  171675. "force_downto": "00000000000000000000000000000001",
  171676. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171677. }
  171678. },
  171679. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  171680. "hide_name": 0,
  171681. "bits": [ 1425 ],
  171682. "attributes": {
  171683. "abc9_carry": "00000000000000000000000000000001",
  171684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171685. }
  171686. },
  171687. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_5_I2_SB_LUT4_O_I2": {
  171688. "hide_name": 0,
  171689. "bits": [ 1420, 1421, 1375 ],
  171690. "attributes": {
  171691. "force_downto": "00000000000000000000000000000001",
  171692. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171693. }
  171694. },
  171695. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3": {
  171696. "hide_name": 0,
  171697. "bits": [ 1366, 1367, 1368 ],
  171698. "attributes": {
  171699. "force_downto": "00000000000000000000000000000001",
  171700. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171701. }
  171702. },
  171703. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1": {
  171704. "hide_name": 0,
  171705. "bits": [ 1428, 1380, 1429 ],
  171706. "attributes": {
  171707. "force_downto": "00000000000000000000000000000001",
  171708. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171709. }
  171710. },
  171711. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3": {
  171712. "hide_name": 0,
  171713. "bits": [ 1432, 1378, 1433 ],
  171714. "attributes": {
  171715. "force_downto": "00000000000000000000000000000001",
  171716. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171717. }
  171718. },
  171719. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  171720. "hide_name": 0,
  171721. "bits": [ 1435 ],
  171722. "attributes": {
  171723. "abc9_carry": "00000000000000000000000000000001",
  171724. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171725. }
  171726. },
  171727. "cpu_I.IBusCachedPlugin_cache._zz_5__SB_LUT4_O_I3_SB_LUT4_O_I1_SB_LUT4_O_I2": {
  171728. "hide_name": 0,
  171729. "bits": [ 1430, 1391, 1431, 1393 ],
  171730. "attributes": {
  171731. "force_downto": "00000000000000000000000000000001",
  171732. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171733. }
  171734. },
  171735. "cpu_I.IBusCachedPlugin_cache._zz_6_": {
  171736. "hide_name": 0,
  171737. "bits": [ 1472 ],
  171738. "attributes": {
  171739. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_6_",
  171740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:124.23-124.29"
  171741. }
  171742. },
  171743. "cpu_I.IBusCachedPlugin_cache._zz_7_": {
  171744. "hide_name": 0,
  171745. "bits": [ 6999, "x", 7000, 7001, 7002, 7003, 7004, 7005, 7006, 7007, 7008, 7009, 7010, 7011, 7012, 7013, 7014, 7015, 7016, 7017, 7018, 7019, 7020 ],
  171746. "attributes": {
  171747. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_7_",
  171748. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:128.23-128.29",
  171749. "unused_bits": "0 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22"
  171750. }
  171751. },
  171752. "cpu_I.IBusCachedPlugin_cache._zz_8_": {
  171753. "hide_name": 0,
  171754. "bits": [ 1439, 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369 ],
  171755. "attributes": {
  171756. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_8_",
  171757. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:129.23-129.29"
  171758. }
  171759. },
  171760. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1": {
  171761. "hide_name": 0,
  171762. "bits": [ 1440, 1441, 1367, 1442 ],
  171763. "attributes": {
  171764. "force_downto": "00000000000000000000000000000001",
  171765. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171766. }
  171767. },
  171768. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_1_I2": {
  171769. "hide_name": 0,
  171770. "bits": [ 1446, 1378, 1447, 1380 ],
  171771. "attributes": {
  171772. "force_downto": "00000000000000000000000000000001",
  171773. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171774. }
  171775. },
  171776. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  171777. "hide_name": 0,
  171778. "bits": [ 1426 ],
  171779. "attributes": {
  171780. "abc9_carry": "00000000000000000000000000000001",
  171781. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171782. }
  171783. },
  171784. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I2": {
  171785. "hide_name": 0,
  171786. "bits": [ 1444, 1391, 1445, 1393 ],
  171787. "attributes": {
  171788. "force_downto": "00000000000000000000000000000001",
  171789. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171790. }
  171791. },
  171792. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I3": {
  171793. "hide_name": 0,
  171794. "bits": [ 1391, 1393 ],
  171795. "attributes": {
  171796. "force_downto": "00000000000000000000000000000001",
  171797. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171798. }
  171799. },
  171800. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_1_I1_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  171801. "hide_name": 0,
  171802. "bits": [ 1817, 1450, 1375 ],
  171803. "attributes": {
  171804. "force_downto": "00000000000000000000000000000001",
  171805. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171806. }
  171807. },
  171808. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3": {
  171809. "hide_name": 0,
  171810. "bits": [ 1451, 1367, 1452 ],
  171811. "attributes": {
  171812. "force_downto": "00000000000000000000000000000001",
  171813. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171814. }
  171815. },
  171816. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O_I1": {
  171817. "hide_name": 0,
  171818. "bits": [ 1454, 1455, 1375, 1456 ],
  171819. "attributes": {
  171820. "force_downto": "00000000000000000000000000000001",
  171821. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171822. }
  171823. },
  171824. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I1": {
  171825. "hide_name": 0,
  171826. "bits": [ 1457, 1458, 1378, 1380 ],
  171827. "attributes": {
  171828. "force_downto": "00000000000000000000000000000001",
  171829. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171830. }
  171831. },
  171832. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_2_I3_SB_LUT4_O_I1_SB_LUT4_O_1_I1_SB_LUT4_O_I3": {
  171833. "hide_name": 0,
  171834. "bits": [ 1448 ],
  171835. "attributes": {
  171836. "abc9_carry": "00000000000000000000000000000001",
  171837. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  171838. }
  171839. },
  171840. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2": {
  171841. "hide_name": 0,
  171842. "bits": [ 1436, 1367, 1437, 1438 ],
  171843. "attributes": {
  171844. "force_downto": "00000000000000000000000000000001",
  171845. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171846. }
  171847. },
  171848. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1": {
  171849. "hide_name": 0,
  171850. "bits": [ 1461, 1462, 1378, 1380 ],
  171851. "attributes": {
  171852. "force_downto": "00000000000000000000000000000001",
  171853. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171854. }
  171855. },
  171856. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1": {
  171857. "hide_name": 0,
  171858. "bits": [ "0", 1463, 1464, "0" ],
  171859. "attributes": {
  171860. "force_downto": "00000000000000000000000000000001",
  171861. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171862. }
  171863. },
  171864. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_DFFR_Q_D": {
  171865. "hide_name": 0,
  171866. "bits": [ 1465 ],
  171867. "attributes": {
  171868. }
  171869. },
  171870. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3": {
  171871. "hide_name": 0,
  171872. "bits": [ 1468, 1469, 1466, 1467 ],
  171873. "attributes": {
  171874. "force_downto": "00000000000000000000000000000001",
  171875. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171876. }
  171877. },
  171878. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0": {
  171879. "hide_name": 0,
  171880. "bits": [ 1468, 1471, 1469, 1472 ],
  171881. "attributes": {
  171882. "force_downto": "00000000000000000000000000000001",
  171883. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171884. }
  171885. },
  171886. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I0_O": {
  171887. "hide_name": 0,
  171888. "bits": [ 1481, 1469, 1466, 1473 ],
  171889. "attributes": {
  171890. "force_downto": "00000000000000000000000000000001",
  171891. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171892. }
  171893. },
  171894. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I0_O_SB_LUT4_I3_O": {
  171895. "hide_name": 0,
  171896. "bits": [ 1474 ],
  171897. "attributes": {
  171898. "defaultvalue": "1",
  171899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116|/usr/bin/../share/yosys/ice40/cells_sim.v:656.8-656.9"
  171900. }
  171901. },
  171902. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_I0_SB_LUT4_I2_O": {
  171903. "hide_name": 0,
  171904. "bits": [ 1358, 1359, 1360 ],
  171905. "attributes": {
  171906. "force_downto": "00000000000000000000000000000001",
  171907. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171908. }
  171909. },
  171910. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_I3_O": {
  171911. "hide_name": 0,
  171912. "bits": [ 1470 ],
  171913. "attributes": {
  171914. }
  171915. },
  171916. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_1_I1_SB_LUT4_O_I1_SB_LUT4_I0_I3_SB_LUT4_O_I2": {
  171917. "hide_name": 0,
  171918. "bits": [ 1477, 1472 ],
  171919. "attributes": {
  171920. "force_downto": "00000000000000000000000000000001",
  171921. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171922. }
  171923. },
  171924. "cpu_I.IBusCachedPlugin_cache._zz_8__SB_LUT4_O_I2_SB_LUT4_O_I2": {
  171925. "hide_name": 0,
  171926. "bits": [ 1459, 1460, 1375 ],
  171927. "attributes": {
  171928. "force_downto": "00000000000000000000000000000001",
  171929. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  171930. }
  171931. },
  171932. "cpu_I.IBusCachedPlugin_cache._zz_9_": {
  171933. "hide_name": 0,
  171934. "bits": [ 1472 ],
  171935. "attributes": {
  171936. "hdlname": "cpu_I IBusCachedPlugin_cache _zz_9_",
  171937. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:130.23-130.29"
  171938. }
  171939. },
  171940. "cpu_I.IBusCachedPlugin_cache.clk": {
  171941. "hide_name": 0,
  171942. "bits": [ 42 ],
  171943. "attributes": {
  171944. "hdlname": "cpu_I IBusCachedPlugin_cache clk",
  171945. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:89.23-89.26"
  171946. }
  171947. },
  171948. "cpu_I.IBusCachedPlugin_cache.decodeStage_hit_valid": {
  171949. "hide_name": 0,
  171950. "bits": [ 1480 ],
  171951. "attributes": {
  171952. "hdlname": "cpu_I IBusCachedPlugin_cache decodeStage_hit_valid",
  171953. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:145.23-145.44"
  171954. }
  171955. },
  171956. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_physicalAddress": {
  171957. "hide_name": 0,
  171958. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  171959. "attributes": {
  171960. "hdlname": "cpu_I IBusCachedPlugin_cache decodeStage_mmuRsp_physicalAddress",
  171961. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:138.23-138.57"
  171962. }
  171963. },
  171964. "cpu_I.IBusCachedPlugin_cache.decodeStage_mmuRsp_refilling": {
  171965. "hide_name": 0,
  171966. "bits": [ "0" ],
  171967. "attributes": {
  171968. "hdlname": "cpu_I IBusCachedPlugin_cache decodeStage_mmuRsp_refilling",
  171969. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:144.23-144.51"
  171970. }
  171971. },
  171972. "cpu_I.IBusCachedPlugin_cache.fetchStage_hit_data": {
  171973. "hide_name": 0,
  171974. "bits": [ 1334, 1259, 1262, 1295, 1328, 1337, 1340, 1343, 1346, 1349, 1352, 1265, 1268, 1271, 1274, 1331, 1325, 1322, 1319, 1316, 1313, 1310, 1307, 1304, 1301, 1277, 1280, 1283, 1286, 1289, 1292, 1298 ],
  171975. "attributes": {
  171976. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_hit_data",
  171977. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:135.23-135.42"
  171978. }
  171979. },
  171980. "cpu_I.IBusCachedPlugin_cache.fetchStage_hit_error": {
  171981. "hide_name": 0,
  171982. "bits": [ "x" ],
  171983. "attributes": {
  171984. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_hit_error",
  171985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:134.23-134.43"
  171986. }
  171987. },
  171988. "cpu_I.IBusCachedPlugin_cache.fetchStage_hit_hits_0": {
  171989. "hide_name": 0,
  171990. "bits": [ 1479 ],
  171991. "attributes": {
  171992. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_hit_hits_0",
  171993. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:132.23-132.44"
  171994. }
  171995. },
  171996. "cpu_I.IBusCachedPlugin_cache.fetchStage_hit_valid": {
  171997. "hide_name": 0,
  171998. "bits": [ 1479 ],
  171999. "attributes": {
  172000. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_hit_valid",
  172001. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:133.23-133.43"
  172002. }
  172003. },
  172004. "cpu_I.IBusCachedPlugin_cache.fetchStage_hit_word": {
  172005. "hide_name": 0,
  172006. "bits": [ 1334, 1259, 1262, 1295, 1328, 1337, 1340, 1343, 1346, 1349, 1352, 1265, 1268, 1271, 1274, 1331, 1325, 1322, 1319, 1316, 1313, 1310, 1307, 1304, 1301, 1277, 1280, 1283, 1286, 1289, 1292, 1298 ],
  172007. "attributes": {
  172008. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_hit_word",
  172009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:136.23-136.42"
  172010. }
  172011. },
  172012. "cpu_I.IBusCachedPlugin_cache.fetchStage_read_waysValues_0_data": {
  172013. "hide_name": 0,
  172014. "bits": [ 1334, 1259, 1262, 1295, 1328, 1337, 1340, 1343, 1346, 1349, 1352, 1265, 1268, 1271, 1274, 1331, 1325, 1322, 1319, 1316, 1313, 1310, 1307, 1304, 1301, 1277, 1280, 1283, 1286, 1289, 1292, 1298 ],
  172015. "attributes": {
  172016. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_read_waysValues_0_data",
  172017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:131.23-131.56"
  172018. }
  172019. },
  172020. "cpu_I.IBusCachedPlugin_cache.fetchStage_read_waysValues_0_tag_address": {
  172021. "hide_name": 0,
  172022. "bits": [ 7000, 7001, 7002, 7003, 7004, 7005, 7006, 7007, 7008, 7009, 7010, 7011, 7012, 7013, 7014, 7015, 7016, 7017, 7018, 7019, 7020 ],
  172023. "attributes": {
  172024. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_read_waysValues_0_tag_address",
  172025. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:127.23-127.63",
  172026. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20"
  172027. }
  172028. },
  172029. "cpu_I.IBusCachedPlugin_cache.fetchStage_read_waysValues_0_tag_error": {
  172030. "hide_name": 0,
  172031. "bits": [ "x" ],
  172032. "attributes": {
  172033. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_read_waysValues_0_tag_error",
  172034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:126.23-126.61"
  172035. }
  172036. },
  172037. "cpu_I.IBusCachedPlugin_cache.fetchStage_read_waysValues_0_tag_valid": {
  172038. "hide_name": 0,
  172039. "bits": [ 6999 ],
  172040. "attributes": {
  172041. "hdlname": "cpu_I IBusCachedPlugin_cache fetchStage_read_waysValues_0_tag_valid",
  172042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:125.23-125.61",
  172043. "unused_bits": "0 "
  172044. }
  172045. },
  172046. "cpu_I.IBusCachedPlugin_cache.io_cpu_decode_data": {
  172047. "hide_name": 0,
  172048. "bits": [ 1545, 1544, 2328, 1364, 1543, 2329, 1363, 2853, 1542, 1541, 1539, 1538, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1530, 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1821 ],
  172049. "attributes": {
  172050. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_decode_data",
  172051. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:74.23-74.41"
  172052. }
  172053. },
  172054. "cpu_I.IBusCachedPlugin_cache.io_cpu_decode_isUser": {
  172055. "hide_name": 0,
  172056. "bits": [ "0" ],
  172057. "attributes": {
  172058. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_decode_isUser",
  172059. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:79.23-79.43"
  172060. }
  172061. },
  172062. "cpu_I.IBusCachedPlugin_cache.io_cpu_decode_mmuRefilling": {
  172063. "hide_name": 0,
  172064. "bits": [ "0" ],
  172065. "attributes": {
  172066. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_decode_mmuRefilling",
  172067. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:77.23-77.49"
  172068. }
  172069. },
  172070. "cpu_I.IBusCachedPlugin_cache.io_cpu_decode_pc": {
  172071. "hide_name": 0,
  172072. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  172073. "attributes": {
  172074. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_decode_pc",
  172075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:72.23-72.39"
  172076. }
  172077. },
  172078. "cpu_I.IBusCachedPlugin_cache.io_cpu_decode_physicalAddress": {
  172079. "hide_name": 0,
  172080. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  172081. "attributes": {
  172082. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_decode_physicalAddress",
  172083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:73.23-73.52"
  172084. }
  172085. },
  172086. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data": {
  172087. "hide_name": 0,
  172088. "bits": [ 1334, 1259, 1262, 1295, 1328, 1337, 1340, 1343, 1346, 1349, 1352, 1265, 1268, 1271, 1274, 1331, 1325, 1322, 1319, 1316, 1313, 1310, 1307, 1304, 1301, 1277, 1280, 1283, 1286, 1289, 1292, 1298 ],
  172089. "attributes": {
  172090. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_data",
  172091. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:55.23-55.40"
  172092. }
  172093. },
  172094. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_data_regNextWhen": {
  172095. "hide_name": 0,
  172096. "bits": [ 1545, 1544, 2328, 1364, 1543, 2329, 1363, 2853, 1542, 1541, 1539, 1538, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1530, 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1821 ],
  172097. "attributes": {
  172098. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_data_regNextWhen",
  172099. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:137.23-137.52"
  172100. }
  172101. },
  172102. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_haltIt": {
  172103. "hide_name": 0,
  172104. "bits": [ "0" ],
  172105. "attributes": {
  172106. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_haltIt",
  172107. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:69.23-69.42"
  172108. }
  172109. },
  172110. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_busy": {
  172111. "hide_name": 0,
  172112. "bits": [ "0" ],
  172113. "attributes": {
  172114. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_busy",
  172115. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:67.23-67.47"
  172116. }
  172117. },
  172118. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_cmd_bypassTranslation": {
  172119. "hide_name": 0,
  172120. "bits": [ "0" ],
  172121. "attributes": {
  172122. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_cmd_bypassTranslation",
  172123. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:58.23-58.64"
  172124. }
  172125. },
  172126. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_cmd_virtualAddress": {
  172127. "hide_name": 0,
  172128. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  172129. "attributes": {
  172130. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_cmd_virtualAddress",
  172131. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:57.23-57.61"
  172132. }
  172133. },
  172134. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_allowExecute": {
  172135. "hide_name": 0,
  172136. "bits": [ "1" ],
  172137. "attributes": {
  172138. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_allowExecute",
  172139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:63.23-63.59"
  172140. }
  172141. },
  172142. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_allowRead": {
  172143. "hide_name": 0,
  172144. "bits": [ "1" ],
  172145. "attributes": {
  172146. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_allowRead",
  172147. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:61.23-61.56"
  172148. }
  172149. },
  172150. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_allowWrite": {
  172151. "hide_name": 0,
  172152. "bits": [ "1" ],
  172153. "attributes": {
  172154. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_allowWrite",
  172155. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:62.23-62.57"
  172156. }
  172157. },
  172158. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_exception": {
  172159. "hide_name": 0,
  172160. "bits": [ "0" ],
  172161. "attributes": {
  172162. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_exception",
  172163. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:64.23-64.56"
  172164. }
  172165. },
  172166. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_isIoAccess": {
  172167. "hide_name": 0,
  172168. "bits": [ 1482 ],
  172169. "attributes": {
  172170. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_isIoAccess",
  172171. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:60.23-60.57"
  172172. }
  172173. },
  172174. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_isIoAccess_SB_LUT4_I3_O": {
  172175. "hide_name": 0,
  172176. "bits": [ 1557, 1761, 1762, 1749 ],
  172177. "attributes": {
  172178. "force_downto": "00000000000000000000000000000001",
  172179. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172180. }
  172181. },
  172182. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_physicalAddress": {
  172183. "hide_name": 0,
  172184. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  172185. "attributes": {
  172186. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_physicalAddress",
  172187. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:59.23-59.62"
  172188. }
  172189. },
  172190. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_mmuBus_rsp_refilling": {
  172191. "hide_name": 0,
  172192. "bits": [ "0" ],
  172193. "attributes": {
  172194. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_mmuBus_rsp_refilling",
  172195. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:65.23-65.56"
  172196. }
  172197. },
  172198. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_pc": {
  172199. "hide_name": 0,
  172200. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  172201. "attributes": {
  172202. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_pc",
  172203. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:54.23-54.38"
  172204. }
  172205. },
  172206. "cpu_I.IBusCachedPlugin_cache.io_cpu_fetch_physicalAddress": {
  172207. "hide_name": 0,
  172208. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  172209. "attributes": {
  172210. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fetch_physicalAddress",
  172211. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:68.23-68.51"
  172212. }
  172213. },
  172214. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_payload": {
  172215. "hide_name": 0,
  172216. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  172217. "attributes": {
  172218. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fill_payload",
  172219. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:81.23-81.42"
  172220. }
  172221. },
  172222. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_valid": {
  172223. "hide_name": 0,
  172224. "bits": [ 1378 ],
  172225. "attributes": {
  172226. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_fill_valid",
  172227. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:80.23-80.40"
  172228. }
  172229. },
  172230. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_valid_SB_LUT4_O_I3": {
  172231. "hide_name": 0,
  172232. "bits": [ 1480, 1481 ],
  172233. "attributes": {
  172234. "force_downto": "00000000000000000000000000000001",
  172235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172236. }
  172237. },
  172238. "cpu_I.IBusCachedPlugin_cache.io_cpu_fill_valid_SB_LUT4_O_I3_SB_DFFR_Q_D": {
  172239. "hide_name": 0,
  172240. "bits": [ 1558 ],
  172241. "attributes": {
  172242. }
  172243. },
  172244. "cpu_I.IBusCachedPlugin_cache.io_cpu_prefetch_pc": {
  172245. "hide_name": 0,
  172246. "bits": [ "0", "0", 1439, 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1836, 1835, 1834, 1833, 1832, 1831, 1830, 1829, 1828, 1827, 1844, 1843, 1842, 1841, 1840, 1839, 1838, 1837, 1826, 1825, 1553 ],
  172247. "attributes": {
  172248. "hdlname": "cpu_I IBusCachedPlugin_cache io_cpu_prefetch_pc",
  172249. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:50.23-50.41"
  172250. }
  172251. },
  172252. "cpu_I.IBusCachedPlugin_cache.io_mem_cmd_payload_address": {
  172253. "hide_name": 0,
  172254. "bits": [ "0", "0", "0", "0", "0", 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  172255. "attributes": {
  172256. "hdlname": "cpu_I IBusCachedPlugin_cache io_mem_cmd_payload_address",
  172257. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:84.23-84.49"
  172258. }
  172259. },
  172260. "cpu_I.IBusCachedPlugin_cache.io_mem_cmd_payload_size": {
  172261. "hide_name": 0,
  172262. "bits": [ "1", "0", "1" ],
  172263. "attributes": {
  172264. "hdlname": "cpu_I IBusCachedPlugin_cache io_mem_cmd_payload_size",
  172265. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:85.23-85.46"
  172266. }
  172267. },
  172268. "cpu_I.IBusCachedPlugin_cache.io_mem_cmd_valid": {
  172269. "hide_name": 0,
  172270. "bits": [ 738 ],
  172271. "attributes": {
  172272. "hdlname": "cpu_I IBusCachedPlugin_cache io_mem_cmd_valid",
  172273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:82.23-82.39"
  172274. }
  172275. },
  172276. "cpu_I.IBusCachedPlugin_cache.io_mem_rsp_payload_data": {
  172277. "hide_name": 0,
  172278. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  172279. "attributes": {
  172280. "hdlname": "cpu_I IBusCachedPlugin_cache io_mem_rsp_payload_data",
  172281. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:87.23-87.46"
  172282. }
  172283. },
  172284. "cpu_I.IBusCachedPlugin_cache.io_mem_rsp_payload_error": {
  172285. "hide_name": 0,
  172286. "bits": [ "0" ],
  172287. "attributes": {
  172288. "hdlname": "cpu_I IBusCachedPlugin_cache io_mem_rsp_payload_error",
  172289. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:88.23-88.47"
  172290. }
  172291. },
  172292. "cpu_I.IBusCachedPlugin_cache.io_mem_rsp_valid": {
  172293. "hide_name": 0,
  172294. "bits": [ 843 ],
  172295. "attributes": {
  172296. "hdlname": "cpu_I IBusCachedPlugin_cache io_mem_rsp_valid",
  172297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:86.23-86.39"
  172298. }
  172299. },
  172300. "cpu_I.IBusCachedPlugin_cache.lineLoader_address": {
  172301. "hide_name": 0,
  172302. "bits": [ "0", "0", 1563, 1562, 1561, 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  172303. "attributes": {
  172304. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_address",
  172305. "keep": "00000000000000000000000000000001",
  172306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:103.45-103.63",
  172307. "syn_keep": "00000000000000000000000000000001",
  172308. "unused_bits": "2 3 4"
  172309. }
  172310. },
  172311. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter": {
  172312. "hide_name": 0,
  172313. "bits": [ 1578, 1576, 1574, 1572, 1570, 1568, 1353 ],
  172314. "attributes": {
  172315. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_flushCounter",
  172316. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:106.23-106.46"
  172317. }
  172318. },
  172319. "cpu_I.IBusCachedPlugin_cache.lineLoader_flushCounter_SB_DFFESR_Q_E": {
  172320. "hide_name": 0,
  172321. "bits": [ 1476 ],
  172322. "attributes": {
  172323. }
  172324. },
  172325. "cpu_I.IBusCachedPlugin_cache.lineLoader_hadError": {
  172326. "hide_name": 0,
  172327. "bits": [ "0" ],
  172328. "attributes": {
  172329. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_hadError",
  172330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:104.23-104.42"
  172331. }
  172332. },
  172333. "cpu_I.IBusCachedPlugin_cache.lineLoader_wayToAllocate_willClear": {
  172334. "hide_name": 0,
  172335. "bits": [ "0" ],
  172336. "attributes": {
  172337. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_wayToAllocate_willClear",
  172338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:110.23-110.57"
  172339. }
  172340. },
  172341. "cpu_I.IBusCachedPlugin_cache.lineLoader_wayToAllocate_willOverflowIfInc": {
  172342. "hide_name": 0,
  172343. "bits": [ "1" ],
  172344. "attributes": {
  172345. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_wayToAllocate_willOverflowIfInc",
  172346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:111.23-111.65"
  172347. }
  172348. },
  172349. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex": {
  172350. "hide_name": 0,
  172351. "bits": [ 1583, 1582, 1580 ],
  172352. "attributes": {
  172353. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_wordIndex",
  172354. "keep": "00000000000000000000000000000001",
  172355. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:113.45-113.65",
  172356. "syn_keep": "00000000000000000000000000000001"
  172357. }
  172358. },
  172359. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_1_D": {
  172360. "hide_name": 0,
  172361. "bits": [ 1581 ],
  172362. "attributes": {
  172363. }
  172364. },
  172365. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_2_D": {
  172366. "hide_name": 0,
  172367. "bits": [ 1584 ],
  172368. "attributes": {
  172369. }
  172370. },
  172371. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_D": {
  172372. "hide_name": 0,
  172373. "bits": [ 1579 ],
  172374. "attributes": {
  172375. }
  172376. },
  172377. "cpu_I.IBusCachedPlugin_cache.lineLoader_wordIndex_SB_DFFR_Q_D_SB_LUT4_O_I3": {
  172378. "hide_name": 0,
  172379. "bits": [ 1585 ],
  172380. "attributes": {
  172381. "abc9_carry": "00000000000000000000000000000001",
  172382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:294.34-294.65|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  172383. }
  172384. },
  172385. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_data_0_payload_address": {
  172386. "hide_name": 0,
  172387. "bits": [ 1583, 1582, 1580, 700, 698, 696, 694, 692, 717 ],
  172388. "attributes": {
  172389. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_data_0_payload_address",
  172390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:120.23-120.62"
  172391. }
  172392. },
  172393. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_data_0_payload_data": {
  172394. "hide_name": 0,
  172395. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  172396. "attributes": {
  172397. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_data_0_payload_data",
  172398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:121.23-121.59"
  172399. }
  172400. },
  172401. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_data_0_valid": {
  172402. "hide_name": 0,
  172403. "bits": [ 843 ],
  172404. "attributes": {
  172405. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_data_0_valid",
  172406. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:119.23-119.52"
  172407. }
  172408. },
  172409. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_address": {
  172410. "hide_name": 0,
  172411. "bits": [ 1592, 1587, 1588, 1589, 1590, 1591 ],
  172412. "attributes": {
  172413. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_tag_0_payload_address",
  172414. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:115.23-115.61"
  172415. }
  172416. },
  172417. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_address": {
  172418. "hide_name": 0,
  172419. "bits": [ 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  172420. "attributes": {
  172421. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_tag_0_payload_data_address",
  172422. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:118.23-118.66"
  172423. }
  172424. },
  172425. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_error": {
  172426. "hide_name": 0,
  172427. "bits": [ "0" ],
  172428. "attributes": {
  172429. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_tag_0_payload_data_error",
  172430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:117.23-117.64"
  172431. }
  172432. },
  172433. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid": {
  172434. "hide_name": 0,
  172435. "bits": [ 1353 ],
  172436. "attributes": {
  172437. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_tag_0_payload_data_valid",
  172438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:116.23-116.64"
  172439. }
  172440. },
  172441. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D": {
  172442. "hide_name": 0,
  172443. "bits": [ 1593 ],
  172444. "offset": 6,
  172445. "attributes": {
  172446. }
  172447. },
  172448. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  172449. "hide_name": 0,
  172450. "bits": [ 1594 ],
  172451. "attributes": {
  172452. "abc9_carry": "00000000000000000000000000000001",
  172453. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  172454. }
  172455. },
  172456. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  172457. "hide_name": 0,
  172458. "bits": [ 1595 ],
  172459. "attributes": {
  172460. "abc9_carry": "00000000000000000000000000000001",
  172461. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  172462. }
  172463. },
  172464. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  172465. "hide_name": 0,
  172466. "bits": [ 1596 ],
  172467. "attributes": {
  172468. "abc9_carry": "00000000000000000000000000000001",
  172469. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  172470. }
  172471. },
  172472. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O": {
  172473. "hide_name": 0,
  172474. "bits": [ 1577, 1575, 1573, 1571, 1569, 1567, 7021 ],
  172475. "attributes": {
  172476. "force_downto": "00000000000000000000000000000001",
  172477. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27",
  172478. "unused_bits": "6"
  172479. }
  172480. },
  172481. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_2_I3": {
  172482. "hide_name": 0,
  172483. "bits": [ 1597 ],
  172484. "attributes": {
  172485. "abc9_carry": "00000000000000000000000000000001",
  172486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  172487. }
  172488. },
  172489. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_payload_data_valid_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  172490. "hide_name": 0,
  172491. "bits": [ 1598 ],
  172492. "attributes": {
  172493. "abc9_carry": "00000000000000000000000000000001",
  172494. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:307.35-307.66|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  172495. }
  172496. },
  172497. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid": {
  172498. "hide_name": 0,
  172499. "bits": [ 1599 ],
  172500. "attributes": {
  172501. "hdlname": "cpu_I IBusCachedPlugin_cache lineLoader_write_tag_0_valid",
  172502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:114.23-114.51"
  172503. }
  172504. },
  172505. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_DFF_D_Q": {
  172506. "hide_name": 0,
  172507. "bits": [ 1600 ],
  172508. "attributes": {
  172509. "defaultvalue": "1",
  172510. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  172511. }
  172512. },
  172513. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_DFF_D_Q_SB_LUT4_I3_O": {
  172514. "hide_name": 0,
  172515. "bits": [ 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601, 1601 ],
  172516. "attributes": {
  172517. "defaultvalue": "0000000000000000",
  172518. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  172519. }
  172520. },
  172521. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3": {
  172522. "hide_name": 0,
  172523. "bits": [ 842, 1378, 1602 ],
  172524. "attributes": {
  172525. "force_downto": "00000000000000000000000000000001",
  172526. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172527. }
  172528. },
  172529. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_1_I2": {
  172530. "hide_name": 0,
  172531. "bits": [ 841, 1604, 1602 ],
  172532. "attributes": {
  172533. "force_downto": "00000000000000000000000000000001",
  172534. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172535. }
  172536. },
  172537. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  172538. "hide_name": 0,
  172539. "bits": [ 1605 ],
  172540. "attributes": {
  172541. }
  172542. },
  172543. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  172544. "hide_name": 0,
  172545. "bits": [ 1603 ],
  172546. "attributes": {
  172547. }
  172548. },
  172549. "cpu_I.IBusCachedPlugin_cache.lineLoader_write_tag_0_valid_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_DFFR_D_Q": {
  172550. "hide_name": 0,
  172551. "bits": [ 841, 842 ],
  172552. "attributes": {
  172553. "force_downto": "00000000000000000000000000000001",
  172554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172555. }
  172556. },
  172557. "cpu_I.IBusCachedPlugin_cache.reset": {
  172558. "hide_name": 0,
  172559. "bits": [ 127 ],
  172560. "attributes": {
  172561. "hdlname": "cpu_I IBusCachedPlugin_cache reset",
  172562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:90.23-90.28"
  172563. }
  172564. },
  172565. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA": {
  172566. "hide_name": 0,
  172567. "bits": [ 1341, 1342, 1258 ],
  172568. "attributes": {
  172569. "force_downto": "00000000000000000000000000000001",
  172570. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172571. }
  172572. },
  172573. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_1": {
  172574. "hide_name": 0,
  172575. "bits": [ 1293, 1294, 1258 ],
  172576. "attributes": {
  172577. "force_downto": "00000000000000000000000000000001",
  172578. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172579. }
  172580. },
  172581. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_2": {
  172582. "hide_name": 0,
  172583. "bits": [ 1335, 1336, 1258 ],
  172584. "attributes": {
  172585. "force_downto": "00000000000000000000000000000001",
  172586. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172587. }
  172588. },
  172589. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_3": {
  172590. "hide_name": 0,
  172591. "bits": [ 1256, 1257, 1258 ],
  172592. "attributes": {
  172593. "force_downto": "00000000000000000000000000000001",
  172594. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172595. }
  172596. },
  172597. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_4": {
  172598. "hide_name": 0,
  172599. "bits": [ 1338, 1339, 1258 ],
  172600. "attributes": {
  172601. "force_downto": "00000000000000000000000000000001",
  172602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172603. }
  172604. },
  172605. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_5": {
  172606. "hide_name": 0,
  172607. "bits": [ 1260, 1261, 1258 ],
  172608. "attributes": {
  172609. "force_downto": "00000000000000000000000000000001",
  172610. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172611. }
  172612. },
  172613. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_6": {
  172614. "hide_name": 0,
  172615. "bits": [ 1326, 1327, 1258 ],
  172616. "attributes": {
  172617. "force_downto": "00000000000000000000000000000001",
  172618. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172619. }
  172620. },
  172621. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_7": {
  172622. "hide_name": 0,
  172623. "bits": [ 1332, 1606, 1326, 1607, 1260, 1608, 1338, 1609, 1256, 1610, 1335, 1611, 1293, 1612, 1341, 1613 ],
  172624. "attributes": {
  172625. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21",
  172626. "unused_bits": "1 3 5 7 9 11 13 15"
  172627. }
  172628. },
  172629. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_RDATA_8": {
  172630. "hide_name": 0,
  172631. "bits": [ 1332, 1258, 1333 ],
  172632. "attributes": {
  172633. "force_downto": "00000000000000000000000000000001",
  172634. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172635. }
  172636. },
  172637. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR": {
  172638. "hide_name": 0,
  172639. "bits": [ 1618, 1616, 1419, 1400 ],
  172640. "attributes": {
  172641. "force_downto": "00000000000000000000000000000001",
  172642. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172643. }
  172644. },
  172645. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_1": {
  172646. "hide_name": 0,
  172647. "bits": [ 1619, 1615, 1443, 1387 ],
  172648. "attributes": {
  172649. "force_downto": "00000000000000000000000000000001",
  172650. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172651. }
  172652. },
  172653. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_2": {
  172654. "hide_name": 0,
  172655. "bits": [ 1617, 844, 1410, 1630 ],
  172656. "attributes": {
  172657. "force_downto": "00000000000000000000000000000001",
  172658. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172659. }
  172660. },
  172661. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_3": {
  172662. "hide_name": 0,
  172663. "bits": [ 1621, 1614, 1369, 1453 ],
  172664. "attributes": {
  172665. "force_downto": "00000000000000000000000000000001",
  172666. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172667. }
  172668. },
  172669. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WADDR_4": {
  172670. "hide_name": 0,
  172671. "bits": [ 1620, 1586, 1439, 1372 ],
  172672. "attributes": {
  172673. "force_downto": "00000000000000000000000000000001",
  172674. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172675. }
  172676. },
  172677. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE": {
  172678. "hide_name": 0,
  172679. "bits": [ 844 ],
  172680. "attributes": {
  172681. "defaultvalue": "1",
  172682. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  172683. }
  172684. },
  172685. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O": {
  172686. "hide_name": 0,
  172687. "bits": [ 1632, 1633, 1631, 1636 ],
  172688. "attributes": {
  172689. "force_downto": "00000000000000000000000000000001",
  172690. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172691. }
  172692. },
  172693. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WCLKE_SB_LUT4_I1_O_SB_LUT4_O_2_I2": {
  172694. "hide_name": 0,
  172695. "bits": [ 1634, 1635 ],
  172696. "attributes": {
  172697. "force_downto": "00000000000000000000000000000001",
  172698. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172699. }
  172700. },
  172701. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA": {
  172702. "hide_name": 0,
  172703. "bits": [ 1629 ],
  172704. "attributes": {
  172705. }
  172706. },
  172707. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_1": {
  172708. "hide_name": 0,
  172709. "bits": [ 1625 ],
  172710. "attributes": {
  172711. }
  172712. },
  172713. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_2": {
  172714. "hide_name": 0,
  172715. "bits": [ 1627 ],
  172716. "attributes": {
  172717. }
  172718. },
  172719. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_3": {
  172720. "hide_name": 0,
  172721. "bits": [ 1623 ],
  172722. "attributes": {
  172723. }
  172724. },
  172725. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_4": {
  172726. "hide_name": 0,
  172727. "bits": [ 1628 ],
  172728. "attributes": {
  172729. }
  172730. },
  172731. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_5": {
  172732. "hide_name": 0,
  172733. "bits": [ 1624 ],
  172734. "attributes": {
  172735. }
  172736. },
  172737. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_6": {
  172738. "hide_name": 0,
  172739. "bits": [ 1626 ],
  172740. "attributes": {
  172741. }
  172742. },
  172743. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.0_WDATA_7": {
  172744. "hide_name": 0,
  172745. "bits": [ 1622 ],
  172746. "attributes": {
  172747. }
  172748. },
  172749. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA": {
  172750. "hide_name": 0,
  172751. "bits": [ 1329, 1330, 1258 ],
  172752. "attributes": {
  172753. "force_downto": "00000000000000000000000000000001",
  172754. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172755. }
  172756. },
  172757. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_1": {
  172758. "hide_name": 0,
  172759. "bits": [ 1263, 1264, 1258 ],
  172760. "attributes": {
  172761. "force_downto": "00000000000000000000000000000001",
  172762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172763. }
  172764. },
  172765. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_2": {
  172766. "hide_name": 0,
  172767. "bits": [ 1269, 1270, 1258 ],
  172768. "attributes": {
  172769. "force_downto": "00000000000000000000000000000001",
  172770. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172771. }
  172772. },
  172773. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_3": {
  172774. "hide_name": 0,
  172775. "bits": [ 1347, 1348, 1258 ],
  172776. "attributes": {
  172777. "force_downto": "00000000000000000000000000000001",
  172778. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172779. }
  172780. },
  172781. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_4": {
  172782. "hide_name": 0,
  172783. "bits": [ 1272, 1273, 1258 ],
  172784. "attributes": {
  172785. "force_downto": "00000000000000000000000000000001",
  172786. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172787. }
  172788. },
  172789. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_5": {
  172790. "hide_name": 0,
  172791. "bits": [ 1350, 1351, 1258 ],
  172792. "attributes": {
  172793. "force_downto": "00000000000000000000000000000001",
  172794. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172795. }
  172796. },
  172797. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_6": {
  172798. "hide_name": 0,
  172799. "bits": [ 1266, 1267, 1258 ],
  172800. "attributes": {
  172801. "force_downto": "00000000000000000000000000000001",
  172802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172803. }
  172804. },
  172805. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_7": {
  172806. "hide_name": 0,
  172807. "bits": [ 1344, 1637, 1266, 1638, 1350, 1639, 1272, 1640, 1347, 1641, 1269, 1642, 1263, 1643, 1329, 1644 ],
  172808. "attributes": {
  172809. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21",
  172810. "unused_bits": "1 3 5 7 9 11 13 15"
  172811. }
  172812. },
  172813. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_8": {
  172814. "hide_name": 0,
  172815. "bits": [ 1344, 1345, 1258 ],
  172816. "attributes": {
  172817. "force_downto": "00000000000000000000000000000001",
  172818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172819. }
  172820. },
  172821. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_RDATA_SB_DFFE_Q_1_D": {
  172822. "hide_name": 0,
  172823. "bits": [ 1653 ],
  172824. "attributes": {
  172825. }
  172826. },
  172827. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA": {
  172828. "hide_name": 0,
  172829. "bits": [ 1652 ],
  172830. "attributes": {
  172831. }
  172832. },
  172833. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_1": {
  172834. "hide_name": 0,
  172835. "bits": [ 1648 ],
  172836. "attributes": {
  172837. }
  172838. },
  172839. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_2": {
  172840. "hide_name": 0,
  172841. "bits": [ 1650 ],
  172842. "attributes": {
  172843. }
  172844. },
  172845. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_3": {
  172846. "hide_name": 0,
  172847. "bits": [ 1646 ],
  172848. "attributes": {
  172849. }
  172850. },
  172851. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_4": {
  172852. "hide_name": 0,
  172853. "bits": [ 1651 ],
  172854. "attributes": {
  172855. }
  172856. },
  172857. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_5": {
  172858. "hide_name": 0,
  172859. "bits": [ 1647 ],
  172860. "attributes": {
  172861. }
  172862. },
  172863. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_6": {
  172864. "hide_name": 0,
  172865. "bits": [ 1649 ],
  172866. "attributes": {
  172867. }
  172868. },
  172869. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.1_WDATA_7": {
  172870. "hide_name": 0,
  172871. "bits": [ 1645 ],
  172872. "attributes": {
  172873. }
  172874. },
  172875. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA": {
  172876. "hide_name": 0,
  172877. "bits": [ 1302, 1303, 1258 ],
  172878. "attributes": {
  172879. "force_downto": "00000000000000000000000000000001",
  172880. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172881. }
  172882. },
  172883. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_1": {
  172884. "hide_name": 0,
  172885. "bits": [ 1314, 1315, 1258 ],
  172886. "attributes": {
  172887. "force_downto": "00000000000000000000000000000001",
  172888. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172889. }
  172890. },
  172891. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_2": {
  172892. "hide_name": 0,
  172893. "bits": [ 1308, 1309, 1258 ],
  172894. "attributes": {
  172895. "force_downto": "00000000000000000000000000000001",
  172896. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172897. }
  172898. },
  172899. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_3": {
  172900. "hide_name": 0,
  172901. "bits": [ 1320, 1321, 1258 ],
  172902. "attributes": {
  172903. "force_downto": "00000000000000000000000000000001",
  172904. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172905. }
  172906. },
  172907. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_4": {
  172908. "hide_name": 0,
  172909. "bits": [ 1305, 1306, 1258 ],
  172910. "attributes": {
  172911. "force_downto": "00000000000000000000000000000001",
  172912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172913. }
  172914. },
  172915. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_5": {
  172916. "hide_name": 0,
  172917. "bits": [ 1317, 1318, 1258 ],
  172918. "attributes": {
  172919. "force_downto": "00000000000000000000000000000001",
  172920. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172921. }
  172922. },
  172923. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_6": {
  172924. "hide_name": 0,
  172925. "bits": [ 1311, 1312, 1258 ],
  172926. "attributes": {
  172927. "force_downto": "00000000000000000000000000000001",
  172928. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172929. }
  172930. },
  172931. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_7": {
  172932. "hide_name": 0,
  172933. "bits": [ 1323, 1654, 1311, 1655, 1317, 1656, 1305, 1657, 1320, 1658, 1308, 1659, 1314, 1660, 1302, 1661 ],
  172934. "attributes": {
  172935. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21",
  172936. "unused_bits": "1 3 5 7 9 11 13 15"
  172937. }
  172938. },
  172939. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_RDATA_8": {
  172940. "hide_name": 0,
  172941. "bits": [ 1323, 1324, 1258 ],
  172942. "attributes": {
  172943. "force_downto": "00000000000000000000000000000001",
  172944. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  172945. }
  172946. },
  172947. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA": {
  172948. "hide_name": 0,
  172949. "bits": [ 1669 ],
  172950. "attributes": {
  172951. }
  172952. },
  172953. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_1": {
  172954. "hide_name": 0,
  172955. "bits": [ 1665 ],
  172956. "attributes": {
  172957. }
  172958. },
  172959. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_2": {
  172960. "hide_name": 0,
  172961. "bits": [ 1667 ],
  172962. "attributes": {
  172963. }
  172964. },
  172965. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_3": {
  172966. "hide_name": 0,
  172967. "bits": [ 1663 ],
  172968. "attributes": {
  172969. }
  172970. },
  172971. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_4": {
  172972. "hide_name": 0,
  172973. "bits": [ 1668 ],
  172974. "attributes": {
  172975. }
  172976. },
  172977. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_5": {
  172978. "hide_name": 0,
  172979. "bits": [ 1664 ],
  172980. "attributes": {
  172981. }
  172982. },
  172983. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_6": {
  172984. "hide_name": 0,
  172985. "bits": [ 1666 ],
  172986. "attributes": {
  172987. }
  172988. },
  172989. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.2_WDATA_7": {
  172990. "hide_name": 0,
  172991. "bits": [ 1662 ],
  172992. "attributes": {
  172993. }
  172994. },
  172995. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA": {
  172996. "hide_name": 0,
  172997. "bits": [ 1296, 1297, 1258 ],
  172998. "attributes": {
  172999. "force_downto": "00000000000000000000000000000001",
  173000. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173001. }
  173002. },
  173003. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_1": {
  173004. "hide_name": 0,
  173005. "bits": [ 1281, 1282, 1258 ],
  173006. "attributes": {
  173007. "force_downto": "00000000000000000000000000000001",
  173008. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173009. }
  173010. },
  173011. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_2": {
  173012. "hide_name": 0,
  173013. "bits": [ 1287, 1288, 1258 ],
  173014. "attributes": {
  173015. "force_downto": "00000000000000000000000000000001",
  173016. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173017. }
  173018. },
  173019. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_3": {
  173020. "hide_name": 0,
  173021. "bits": [ 1275, 1276, 1258 ],
  173022. "attributes": {
  173023. "force_downto": "00000000000000000000000000000001",
  173024. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173025. }
  173026. },
  173027. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_4": {
  173028. "hide_name": 0,
  173029. "bits": [ 1290, 1291, 1258 ],
  173030. "attributes": {
  173031. "force_downto": "00000000000000000000000000000001",
  173032. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173033. }
  173034. },
  173035. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_5": {
  173036. "hide_name": 0,
  173037. "bits": [ 1278, 1279, 1258 ],
  173038. "attributes": {
  173039. "force_downto": "00000000000000000000000000000001",
  173040. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173041. }
  173042. },
  173043. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_6": {
  173044. "hide_name": 0,
  173045. "bits": [ 1284, 1285, 1258 ],
  173046. "attributes": {
  173047. "force_downto": "00000000000000000000000000000001",
  173048. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173049. }
  173050. },
  173051. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_7": {
  173052. "hide_name": 0,
  173053. "bits": [ 1299, 1670, 1284, 1671, 1278, 1672, 1290, 1673, 1275, 1674, 1287, 1675, 1281, 1676, 1296, 1677 ],
  173054. "attributes": {
  173055. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21",
  173056. "unused_bits": "1 3 5 7 9 11 13 15"
  173057. }
  173058. },
  173059. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_RDATA_8": {
  173060. "hide_name": 0,
  173061. "bits": [ 1299, 1300, 1258 ],
  173062. "attributes": {
  173063. "force_downto": "00000000000000000000000000000001",
  173064. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173065. }
  173066. },
  173067. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA": {
  173068. "hide_name": 0,
  173069. "bits": [ 1685 ],
  173070. "attributes": {
  173071. }
  173072. },
  173073. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_1": {
  173074. "hide_name": 0,
  173075. "bits": [ 1681 ],
  173076. "attributes": {
  173077. }
  173078. },
  173079. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_2": {
  173080. "hide_name": 0,
  173081. "bits": [ 1683 ],
  173082. "attributes": {
  173083. }
  173084. },
  173085. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_3": {
  173086. "hide_name": 0,
  173087. "bits": [ 1679 ],
  173088. "attributes": {
  173089. }
  173090. },
  173091. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_4": {
  173092. "hide_name": 0,
  173093. "bits": [ 1684 ],
  173094. "attributes": {
  173095. }
  173096. },
  173097. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_5": {
  173098. "hide_name": 0,
  173099. "bits": [ 1680 ],
  173100. "attributes": {
  173101. }
  173102. },
  173103. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_6": {
  173104. "hide_name": 0,
  173105. "bits": [ 1682 ],
  173106. "attributes": {
  173107. }
  173108. },
  173109. "cpu_I.IBusCachedPlugin_cache.ways_0_datas.0.3_WDATA_7": {
  173110. "hide_name": 0,
  173111. "bits": [ 1678 ],
  173112. "attributes": {
  173113. }
  173114. },
  173115. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA": {
  173116. "hide_name": 0,
  173117. "bits": [ 1701, 1778, 1556 ],
  173118. "attributes": {
  173119. "force_downto": "00000000000000000000000000000001",
  173120. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173121. }
  173122. },
  173123. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_1": {
  173124. "hide_name": 0,
  173125. "bits": [ 1700, 1740, 1556 ],
  173126. "attributes": {
  173127. "force_downto": "00000000000000000000000000000001",
  173128. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173129. }
  173130. },
  173131. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_10": {
  173132. "hide_name": 0,
  173133. "bits": [ 1691, 1722, 1556, 1490 ],
  173134. "attributes": {
  173135. "force_downto": "00000000000000000000000000000001",
  173136. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173137. }
  173138. },
  173139. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_11": {
  173140. "hide_name": 0,
  173141. "bits": [ 1690, 1724, 1556 ],
  173142. "attributes": {
  173143. "force_downto": "00000000000000000000000000000001",
  173144. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173145. }
  173146. },
  173147. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_11_SB_LUT4_I1_O": {
  173148. "hide_name": 0,
  173149. "bits": [ 1508, 1725, 1726 ],
  173150. "attributes": {
  173151. "force_downto": "00000000000000000000000000000001",
  173152. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173153. }
  173154. },
  173155. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_12": {
  173156. "hide_name": 0,
  173157. "bits": [ 1689, 1730, 1556, 1486 ],
  173158. "attributes": {
  173159. "force_downto": "00000000000000000000000000000001",
  173160. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173161. }
  173162. },
  173163. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_12_SB_LUT4_I0_O": {
  173164. "hide_name": 0,
  173165. "bits": [ 1516, 1813, 1731 ],
  173166. "attributes": {
  173167. "force_downto": "00000000000000000000000000000001",
  173168. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173169. }
  173170. },
  173171. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_13": {
  173172. "hide_name": 0,
  173173. "bits": [ 1688, 1732, 1556, 1502 ],
  173174. "attributes": {
  173175. "force_downto": "00000000000000000000000000000001",
  173176. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173177. }
  173178. },
  173179. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_13_SB_LUT4_I0_O": {
  173180. "hide_name": 0,
  173181. "bits": [ 1520, 1773, 1733, 1735 ],
  173182. "attributes": {
  173183. "force_downto": "00000000000000000000000000000001",
  173184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173185. }
  173186. },
  173187. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_14": {
  173188. "hide_name": 0,
  173189. "bits": [ 1687, 1736, 1556 ],
  173190. "attributes": {
  173191. "force_downto": "00000000000000000000000000000001",
  173192. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173193. }
  173194. },
  173195. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_15": {
  173196. "hide_name": 0,
  173197. "bits": [ 1686, 1738, 1556, 1739 ],
  173198. "attributes": {
  173199. "force_downto": "00000000000000000000000000000001",
  173200. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173201. }
  173202. },
  173203. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_1_SB_LUT4_I1_O": {
  173204. "hide_name": 0,
  173205. "bits": [ 1496, 1734, 1741 ],
  173206. "attributes": {
  173207. "force_downto": "00000000000000000000000000000001",
  173208. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173209. }
  173210. },
  173211. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2": {
  173212. "hide_name": 0,
  173213. "bits": [ 1699, 1745, 1556 ],
  173214. "attributes": {
  173215. "force_downto": "00000000000000000000000000000001",
  173216. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173217. }
  173218. },
  173219. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_2_SB_LUT4_I1_O": {
  173220. "hide_name": 0,
  173221. "bits": [ 1488, 1746, 1747, 1748 ],
  173222. "attributes": {
  173223. "force_downto": "00000000000000000000000000000001",
  173224. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173225. }
  173226. },
  173227. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3": {
  173228. "hide_name": 0,
  173229. "bits": [ 1698, 1750, 1556 ],
  173230. "attributes": {
  173231. "force_downto": "00000000000000000000000000000001",
  173232. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173233. }
  173234. },
  173235. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_3_SB_LUT4_I1_O": {
  173236. "hide_name": 0,
  173237. "bits": [ 1504, 1751, 1753 ],
  173238. "attributes": {
  173239. "force_downto": "00000000000000000000000000000001",
  173240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173241. }
  173242. },
  173243. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4": {
  173244. "hide_name": 0,
  173245. "bits": [ 1697, 1756, 1556 ],
  173246. "attributes": {
  173247. "force_downto": "00000000000000000000000000000001",
  173248. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173249. }
  173250. },
  173251. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1_O": {
  173252. "hide_name": 0,
  173253. "bits": [ 1522, 1757, 1758, 1759 ],
  173254. "attributes": {
  173255. "force_downto": "00000000000000000000000000000001",
  173256. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173257. }
  173258. },
  173259. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I1_O": {
  173260. "hide_name": 0,
  173261. "bits": [ 1752, 1742, 1760, 1763 ],
  173262. "attributes": {
  173263. "force_downto": "00000000000000000000000000000001",
  173264. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173265. }
  173266. },
  173267. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5": {
  173268. "hide_name": 0,
  173269. "bits": [ 1696, 1764, 1556 ],
  173270. "attributes": {
  173271. "force_downto": "00000000000000000000000000000001",
  173272. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173273. }
  173274. },
  173275. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1_O": {
  173276. "hide_name": 0,
  173277. "bits": [ 1500, 1765, 1766 ],
  173278. "attributes": {
  173279. "force_downto": "00000000000000000000000000000001",
  173280. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173281. }
  173282. },
  173283. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  173284. "hide_name": 0,
  173285. "bits": [ 1776, 1771, 1767, 1772 ],
  173286. "attributes": {
  173287. "force_downto": "00000000000000000000000000000001",
  173288. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173289. }
  173290. },
  173291. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_6": {
  173292. "hide_name": 0,
  173293. "bits": [ 1695, 1755, 1556, 1492 ],
  173294. "attributes": {
  173295. "force_downto": "00000000000000000000000000000001",
  173296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173297. }
  173298. },
  173299. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_7": {
  173300. "hide_name": 0,
  173301. "bits": [ 1686, 1694, 1690, 1698, 1688, 1696, 1692, 1700, 1687, 1695, 1691, 1699, 1689, 1697, 1693, 1701, 1790, 1795, 1782, 1798, 1743, 1728, 1554 ],
  173302. "attributes": {
  173303. "unused_bits": "1 "
  173304. }
  173305. },
  173306. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_8": {
  173307. "hide_name": 0,
  173308. "bits": [ 1693, 1775, 1556 ],
  173309. "attributes": {
  173310. "force_downto": "00000000000000000000000000000001",
  173311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173312. }
  173313. },
  173314. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_8_SB_LUT4_I1_O": {
  173315. "hide_name": 0,
  173316. "bits": [ 1518, 1520, 1773, 1774 ],
  173317. "attributes": {
  173318. "force_downto": "00000000000000000000000000000001",
  173319. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173320. }
  173321. },
  173322. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_9": {
  173323. "hide_name": 0,
  173324. "bits": [ 1692, 1777, 1556, 1498 ],
  173325. "attributes": {
  173326. "force_downto": "00000000000000000000000000000001",
  173327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173328. }
  173329. },
  173330. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O": {
  173331. "hide_name": 0,
  173332. "bits": [ 1518, 1494, 1737, 1774 ],
  173333. "attributes": {
  173334. "force_downto": "00000000000000000000000000000001",
  173335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173336. }
  173337. },
  173338. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_1_O": {
  173339. "hide_name": 0,
  173340. "bits": [ 1524, 1525, 1526, 1527 ],
  173341. "attributes": {
  173342. "force_downto": "00000000000000000000000000000001",
  173343. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173344. }
  173345. },
  173346. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_I3": {
  173347. "hide_name": 0,
  173348. "bits": [ 1512, 1779 ],
  173349. "attributes": {
  173350. "force_downto": "00000000000000000000000000000001",
  173351. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173352. }
  173353. },
  173354. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  173355. "hide_name": 0,
  173356. "bits": [ 1754, 1780, 1781, 1727 ],
  173357. "attributes": {
  173358. "force_downto": "00000000000000000000000000000001",
  173359. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173360. }
  173361. },
  173362. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR": {
  173363. "hide_name": 0,
  173364. "bits": [ 1707, 1704, 1369, 1400 ],
  173365. "attributes": {
  173366. "force_downto": "00000000000000000000000000000001",
  173367. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173368. }
  173369. },
  173370. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_1": {
  173371. "hide_name": 0,
  173372. "bits": [ 1703, 1600, 1410 ],
  173373. "attributes": {
  173374. "force_downto": "00000000000000000000000000000001",
  173375. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173376. }
  173377. },
  173378. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_2": {
  173379. "hide_name": 0,
  173380. "bits": [ 1702, 1419 ],
  173381. "attributes": {
  173382. "force_downto": "00000000000000000000000000000001",
  173383. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173384. }
  173385. },
  173386. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_2_SB_LUT4_I2_O": {
  173387. "hide_name": 0,
  173388. "bits": [ 1706, 1372, 1785, 1786 ],
  173389. "attributes": {
  173390. "force_downto": "00000000000000000000000000000001",
  173391. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173392. }
  173393. },
  173394. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_3": {
  173395. "hide_name": 0,
  173396. "bits": [ 1705, 1387 ],
  173397. "attributes": {
  173398. "force_downto": "00000000000000000000000000000001",
  173399. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173400. }
  173401. },
  173402. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_4": {
  173403. "hide_name": 0,
  173404. "bits": [ 1707, 1705, 1387, 1369 ],
  173405. "attributes": {
  173406. "force_downto": "00000000000000000000000000000001",
  173407. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173408. }
  173409. },
  173410. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WADDR_SB_LUT4_I1_O": {
  173411. "hide_name": 0,
  173412. "bits": [ 1789, 1784, 1787, 1788 ],
  173413. "attributes": {
  173414. "force_downto": "00000000000000000000000000000001",
  173415. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173416. }
  173417. },
  173418. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA": {
  173419. "hide_name": 0,
  173420. "bits": [ 1721 ],
  173421. "attributes": {
  173422. }
  173423. },
  173424. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_1": {
  173425. "hide_name": 0,
  173426. "bits": [ 1714 ],
  173427. "attributes": {
  173428. }
  173429. },
  173430. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_10": {
  173431. "hide_name": 0,
  173432. "bits": [ 1716 ],
  173433. "attributes": {
  173434. }
  173435. },
  173436. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_11": {
  173437. "hide_name": 0,
  173438. "bits": [ 1709 ],
  173439. "attributes": {
  173440. }
  173441. },
  173442. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_12": {
  173443. "hide_name": 0,
  173444. "bits": [ 1718 ],
  173445. "attributes": {
  173446. }
  173447. },
  173448. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_13": {
  173449. "hide_name": 0,
  173450. "bits": [ 1711 ],
  173451. "attributes": {
  173452. }
  173453. },
  173454. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_2": {
  173455. "hide_name": 0,
  173456. "bits": [ 1717 ],
  173457. "attributes": {
  173458. }
  173459. },
  173460. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_3": {
  173461. "hide_name": 0,
  173462. "bits": [ 1710 ],
  173463. "attributes": {
  173464. }
  173465. },
  173466. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_4": {
  173467. "hide_name": 0,
  173468. "bits": [ 1719 ],
  173469. "attributes": {
  173470. }
  173471. },
  173472. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_5": {
  173473. "hide_name": 0,
  173474. "bits": [ 1712 ],
  173475. "attributes": {
  173476. }
  173477. },
  173478. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_6": {
  173479. "hide_name": 0,
  173480. "bits": [ 1715 ],
  173481. "attributes": {
  173482. }
  173483. },
  173484. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_7": {
  173485. "hide_name": 0,
  173486. "bits": [ 1708 ],
  173487. "attributes": {
  173488. }
  173489. },
  173490. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_8": {
  173491. "hide_name": 0,
  173492. "bits": [ 1720 ],
  173493. "attributes": {
  173494. }
  173495. },
  173496. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.0_WDATA_9": {
  173497. "hide_name": 0,
  173498. "bits": [ 1713 ],
  173499. "attributes": {
  173500. }
  173501. },
  173502. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA": {
  173503. "hide_name": 0,
  173504. "bits": [ 1798, 1814, 1556, 1510 ],
  173505. "attributes": {
  173506. "force_downto": "00000000000000000000000000000001",
  173507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173508. }
  173509. },
  173510. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_1": {
  173511. "hide_name": 0,
  173512. "bits": [ 1728, 1729, 1556, 1484 ],
  173513. "attributes": {
  173514. "force_downto": "00000000000000000000000000000001",
  173515. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173516. }
  173517. },
  173518. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_2": {
  173519. "hide_name": 0,
  173520. "bits": [ 1795, 1809, 1556 ],
  173521. "attributes": {
  173522. "force_downto": "00000000000000000000000000000001",
  173523. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173524. }
  173525. },
  173526. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_3": {
  173527. "hide_name": 0,
  173528. "bits": [ 1554, 1555, 1556, 1482 ],
  173529. "attributes": {
  173530. "force_downto": "00000000000000000000000000000001",
  173531. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173532. }
  173533. },
  173534. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_4": {
  173535. "hide_name": 0,
  173536. "bits": [ 1782, 1783, 1556 ],
  173537. "attributes": {
  173538. "force_downto": "00000000000000000000000000000001",
  173539. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173540. }
  173541. },
  173542. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_4_SB_DFFE_Q_D": {
  173543. "hide_name": 0,
  173544. "bits": [ 1811 ],
  173545. "attributes": {
  173546. }
  173547. },
  173548. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_5": {
  173549. "hide_name": 0,
  173550. "bits": [ 1743, 1744, 1556, 1506 ],
  173551. "attributes": {
  173552. "force_downto": "00000000000000000000000000000001",
  173553. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173554. }
  173555. },
  173556. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_6": {
  173557. "hide_name": 0,
  173558. "bits": [ 1790, 1795, 1782, 1798, 1743, 1728, 1554, 1800, 1791, 1796, 1793, 1799, 1792, 1797, 1794, 1801 ],
  173559. "attributes": {
  173560. "unused_bits": "7 8 9 10 11 12 13 14 15"
  173561. }
  173562. },
  173563. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7": {
  173564. "hide_name": 0,
  173565. "bits": [ 1790, 1812, 1556 ],
  173566. "attributes": {
  173567. "force_downto": "00000000000000000000000000000001",
  173568. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173569. }
  173570. },
  173571. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_7_SB_LUT4_I1_O": {
  173572. "hide_name": 0,
  173573. "bits": [ 1514, 1516, 1810, 1813 ],
  173574. "attributes": {
  173575. "force_downto": "00000000000000000000000000000001",
  173576. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173577. }
  173578. },
  173579. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_RDATA_SB_LUT4_I0_O": {
  173580. "hide_name": 0,
  173581. "bits": [ 1768, 1723, 1769, 1770 ],
  173582. "attributes": {
  173583. "force_downto": "00000000000000000000000000000001",
  173584. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173585. }
  173586. },
  173587. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA": {
  173588. "hide_name": 0,
  173589. "bits": [ 1805 ],
  173590. "attributes": {
  173591. }
  173592. },
  173593. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_1": {
  173594. "hide_name": 0,
  173595. "bits": [ 1807 ],
  173596. "attributes": {
  173597. }
  173598. },
  173599. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_2": {
  173600. "hide_name": 0,
  173601. "bits": [ 1803 ],
  173602. "attributes": {
  173603. }
  173604. },
  173605. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_3": {
  173606. "hide_name": 0,
  173607. "bits": [ 1808 ],
  173608. "attributes": {
  173609. }
  173610. },
  173611. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_4": {
  173612. "hide_name": 0,
  173613. "bits": [ 1804 ],
  173614. "attributes": {
  173615. }
  173616. },
  173617. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_5": {
  173618. "hide_name": 0,
  173619. "bits": [ 1806 ],
  173620. "attributes": {
  173621. }
  173622. },
  173623. "cpu_I.IBusCachedPlugin_cache.ways_0_tags.0.1_WDATA_6": {
  173624. "hide_name": 0,
  173625. "bits": [ 1802 ],
  173626. "attributes": {
  173627. }
  173628. },
  173629. "cpu_I.IBusCachedPlugin_cache_io_cpu_decode_data": {
  173630. "hide_name": 0,
  173631. "bits": [ 1545, 1544, 2328, 1364, 1543, 2329, 1363, 2853, 1542, 1541, 1539, 1538, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1530, 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1821 ],
  173632. "attributes": {
  173633. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_decode_data",
  173634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:389.23-389.64"
  173635. }
  173636. },
  173637. "cpu_I.IBusCachedPlugin_cache_io_cpu_decode_mmuRefilling": {
  173638. "hide_name": 0,
  173639. "bits": [ "0" ],
  173640. "attributes": {
  173641. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_decode_mmuRefilling",
  173642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:387.23-387.72"
  173643. }
  173644. },
  173645. "cpu_I.IBusCachedPlugin_cache_io_cpu_decode_physicalAddress": {
  173646. "hide_name": 0,
  173647. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  173648. "attributes": {
  173649. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_decode_physicalAddress",
  173650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:391.23-391.75"
  173651. }
  173652. },
  173653. "cpu_I.IBusCachedPlugin_cache_io_cpu_fetch_data": {
  173654. "hide_name": 0,
  173655. "bits": [ 1334, 1259, 1262, 1295, 1328, 1337, 1340, 1343, 1346, 1349, 1352, 1265, 1268, 1271, 1274, 1331, 1325, 1322, 1319, 1316, 1313, 1310, 1307, 1304, 1301, 1277, 1280, 1283, 1286, 1289, 1292, 1298 ],
  173656. "attributes": {
  173657. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_fetch_data",
  173658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:379.23-379.63"
  173659. }
  173660. },
  173661. "cpu_I.IBusCachedPlugin_cache_io_cpu_fetch_haltIt": {
  173662. "hide_name": 0,
  173663. "bits": [ "0" ],
  173664. "attributes": {
  173665. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_fetch_haltIt",
  173666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:381.23-381.65"
  173667. }
  173668. },
  173669. "cpu_I.IBusCachedPlugin_cache_io_cpu_fetch_mmuBus_cmd_bypassTranslation": {
  173670. "hide_name": 0,
  173671. "bits": [ "0" ],
  173672. "attributes": {
  173673. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_fetch_mmuBus_cmd_bypassTranslation",
  173674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:384.23-384.87"
  173675. }
  173676. },
  173677. "cpu_I.IBusCachedPlugin_cache_io_cpu_fetch_mmuBus_cmd_virtualAddress": {
  173678. "hide_name": 0,
  173679. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  173680. "attributes": {
  173681. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_fetch_mmuBus_cmd_virtualAddress",
  173682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:383.23-383.84"
  173683. }
  173684. },
  173685. "cpu_I.IBusCachedPlugin_cache_io_cpu_fetch_physicalAddress": {
  173686. "hide_name": 0,
  173687. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  173688. "attributes": {
  173689. "hdlname": "cpu_I IBusCachedPlugin_cache_io_cpu_fetch_physicalAddress",
  173690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:380.23-380.74"
  173691. }
  173692. },
  173693. "cpu_I.IBusCachedPlugin_cache_io_mem_cmd_payload_address": {
  173694. "hide_name": 0,
  173695. "bits": [ "0", "0", "0", "0", "0", 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  173696. "attributes": {
  173697. "hdlname": "cpu_I IBusCachedPlugin_cache_io_mem_cmd_payload_address",
  173698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:393.23-393.72"
  173699. }
  173700. },
  173701. "cpu_I.IBusCachedPlugin_cache_io_mem_cmd_payload_size": {
  173702. "hide_name": 0,
  173703. "bits": [ "1", "0", "1" ],
  173704. "attributes": {
  173705. "hdlname": "cpu_I IBusCachedPlugin_cache_io_mem_cmd_payload_size",
  173706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:394.23-394.69"
  173707. }
  173708. },
  173709. "cpu_I.IBusCachedPlugin_cache_io_mem_cmd_valid": {
  173710. "hide_name": 0,
  173711. "bits": [ 738 ],
  173712. "attributes": {
  173713. "hdlname": "cpu_I IBusCachedPlugin_cache_io_mem_cmd_valid",
  173714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:392.23-392.62"
  173715. }
  173716. },
  173717. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch": {
  173718. "hide_name": 0,
  173719. "bits": [ 1815 ],
  173720. "attributes": {
  173721. "hdlname": "cpu_I IBusCachedPlugin_decodePrediction_cmd_hadBranch",
  173722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:907.23-907.70"
  173723. }
  173724. },
  173725. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3_O": {
  173726. "hide_name": 0,
  173727. "bits": [ "0", 1471, "1", 1816 ],
  173728. "attributes": {
  173729. "force_downto": "00000000000000000000000000000001",
  173730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1482.22-1482.41|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173731. }
  173732. },
  173733. "cpu_I.IBusCachedPlugin_decodePrediction_cmd_hadBranch_SB_LUT4_I3_O_SB_LUT4_I1_O": {
  173734. "hide_name": 0,
  173735. "bits": [ 1845, 1367, 1820, 1818 ],
  173736. "attributes": {
  173737. "force_downto": "00000000000000000000000000000001",
  173738. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173739. }
  173740. },
  173741. "cpu_I.IBusCachedPlugin_fetchPc_output_payload": {
  173742. "hide_name": 0,
  173743. "bits": [ "0", "0", 1439, 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1836, 1835, 1834, 1833, 1832, 1831, 1830, 1829, 1828, 1827, 1844, 1843, 1842, 1841, 1840, 1839, 1838, 1837, 1826, 1825, 1553 ],
  173744. "attributes": {
  173745. "hdlname": "cpu_I IBusCachedPlugin_fetchPc_output_payload",
  173746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:971.23-971.62"
  173747. }
  173748. },
  173749. "cpu_I.IBusCachedPlugin_fetchPc_pc": {
  173750. "hide_name": 0,
  173751. "bits": [ "0", "0", 1439, 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1836, 1835, 1834, 1833, 1832, 1831, 1830, 1829, 1828, 1827, 1844, 1843, 1842, 1841, 1840, 1839, 1838, 1837, 1826, 1825, 1553 ],
  173752. "attributes": {
  173753. "hdlname": "cpu_I IBusCachedPlugin_fetchPc_pc",
  173754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:979.23-979.50"
  173755. }
  173756. },
  173757. "cpu_I.IBusCachedPlugin_fetchPc_pcReg": {
  173758. "hide_name": 0,
  173759. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  173760. "attributes": {
  173761. "hdlname": "cpu_I IBusCachedPlugin_fetchPc_pcReg",
  173762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:972.23-972.53"
  173763. }
  173764. },
  173765. "cpu_I.IBusCachedPlugin_fetchPc_pcRegPropagate": {
  173766. "hide_name": 0,
  173767. "bits": [ 1472 ],
  173768. "attributes": {
  173769. "hdlname": "cpu_I IBusCachedPlugin_fetchPc_pcRegPropagate",
  173770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:976.23-976.62"
  173771. }
  173772. },
  173773. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2": {
  173774. "hide_name": 0,
  173775. "bits": [ 1849, 1367, 1850, 1851 ],
  173776. "attributes": {
  173777. "force_downto": "00000000000000000000000000000001",
  173778. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173779. }
  173780. },
  173781. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_1_I2": {
  173782. "hide_name": 0,
  173783. "bits": [ 1487, 1378, 1854, 1380 ],
  173784. "attributes": {
  173785. "force_downto": "00000000000000000000000000000001",
  173786. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173787. }
  173788. },
  173789. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173790. "hide_name": 0,
  173791. "bits": [ 1855 ],
  173792. "attributes": {
  173793. "abc9_carry": "00000000000000000000000000000001",
  173794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173795. }
  173796. },
  173797. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_10_I2_SB_LUT4_O_I2": {
  173798. "hide_name": 0,
  173799. "bits": [ 1852, 1853, 1375 ],
  173800. "attributes": {
  173801. "force_downto": "00000000000000000000000000000001",
  173802. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173803. }
  173804. },
  173805. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2": {
  173806. "hide_name": 0,
  173807. "bits": [ 1857, 1367, 1858, 1859 ],
  173808. "attributes": {
  173809. "force_downto": "00000000000000000000000000000001",
  173810. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173811. }
  173812. },
  173813. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_1_I2": {
  173814. "hide_name": 0,
  173815. "bits": [ 1523, 1378, 1862, 1380 ],
  173816. "attributes": {
  173817. "force_downto": "00000000000000000000000000000001",
  173818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173819. }
  173820. },
  173821. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173822. "hide_name": 0,
  173823. "bits": [ 1863 ],
  173824. "attributes": {
  173825. "abc9_carry": "00000000000000000000000000000001",
  173826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173827. }
  173828. },
  173829. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_11_I2_SB_LUT4_O_I2": {
  173830. "hide_name": 0,
  173831. "bits": [ 1860, 1861, 1375 ],
  173832. "attributes": {
  173833. "force_downto": "00000000000000000000000000000001",
  173834. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173835. }
  173836. },
  173837. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2": {
  173838. "hide_name": 0,
  173839. "bits": [ 1864, 1367, 1865, 1866 ],
  173840. "attributes": {
  173841. "force_downto": "00000000000000000000000000000001",
  173842. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173843. }
  173844. },
  173845. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_1_I2": {
  173846. "hide_name": 0,
  173847. "bits": [ 1521, 1378, 1869, 1380 ],
  173848. "attributes": {
  173849. "force_downto": "00000000000000000000000000000001",
  173850. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173851. }
  173852. },
  173853. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173854. "hide_name": 0,
  173855. "bits": [ 1870 ],
  173856. "attributes": {
  173857. "abc9_carry": "00000000000000000000000000000001",
  173858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173859. }
  173860. },
  173861. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_12_I2_SB_LUT4_O_I2": {
  173862. "hide_name": 0,
  173863. "bits": [ 1867, 1868, 1375 ],
  173864. "attributes": {
  173865. "force_downto": "00000000000000000000000000000001",
  173866. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173867. }
  173868. },
  173869. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2": {
  173870. "hide_name": 0,
  173871. "bits": [ 1871, 1367, 1872, 1873 ],
  173872. "attributes": {
  173873. "force_downto": "00000000000000000000000000000001",
  173874. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173875. }
  173876. },
  173877. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_1_I2": {
  173878. "hide_name": 0,
  173879. "bits": [ 1519, 1378, 1876, 1380 ],
  173880. "attributes": {
  173881. "force_downto": "00000000000000000000000000000001",
  173882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173883. }
  173884. },
  173885. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173886. "hide_name": 0,
  173887. "bits": [ 1877 ],
  173888. "attributes": {
  173889. "abc9_carry": "00000000000000000000000000000001",
  173890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173891. }
  173892. },
  173893. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_13_I2_SB_LUT4_O_I2": {
  173894. "hide_name": 0,
  173895. "bits": [ 1874, 1875, 1375 ],
  173896. "attributes": {
  173897. "force_downto": "00000000000000000000000000000001",
  173898. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173899. }
  173900. },
  173901. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2": {
  173902. "hide_name": 0,
  173903. "bits": [ 1878, 1367, 1879, 1880 ],
  173904. "attributes": {
  173905. "force_downto": "00000000000000000000000000000001",
  173906. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173907. }
  173908. },
  173909. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_1_I2": {
  173910. "hide_name": 0,
  173911. "bits": [ 1517, 1378, 1883, 1380 ],
  173912. "attributes": {
  173913. "force_downto": "00000000000000000000000000000001",
  173914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173915. }
  173916. },
  173917. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173918. "hide_name": 0,
  173919. "bits": [ 1884 ],
  173920. "attributes": {
  173921. "abc9_carry": "00000000000000000000000000000001",
  173922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173923. }
  173924. },
  173925. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_14_I2_SB_LUT4_O_I2": {
  173926. "hide_name": 0,
  173927. "bits": [ 1881, 1882, 1375 ],
  173928. "attributes": {
  173929. "force_downto": "00000000000000000000000000000001",
  173930. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173931. }
  173932. },
  173933. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2": {
  173934. "hide_name": 0,
  173935. "bits": [ 1367, 1885, 1886, 1887 ],
  173936. "attributes": {
  173937. "force_downto": "00000000000000000000000000000001",
  173938. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173939. }
  173940. },
  173941. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2": {
  173942. "hide_name": 0,
  173943. "bits": [ 1515, 1378, 1890, 1380 ],
  173944. "attributes": {
  173945. "force_downto": "00000000000000000000000000000001",
  173946. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173947. }
  173948. },
  173949. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173950. "hide_name": 0,
  173951. "bits": [ 1891 ],
  173952. "attributes": {
  173953. "abc9_carry": "00000000000000000000000000000001",
  173954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173955. }
  173956. },
  173957. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_15_I2_SB_LUT4_O_I2": {
  173958. "hide_name": 0,
  173959. "bits": [ 1888, 1889, 1375 ],
  173960. "attributes": {
  173961. "force_downto": "00000000000000000000000000000001",
  173962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173963. }
  173964. },
  173965. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1": {
  173966. "hide_name": 0,
  173967. "bits": [ 1367, 1892, 1893, 1894 ],
  173968. "attributes": {
  173969. "force_downto": "00000000000000000000000000000001",
  173970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173971. }
  173972. },
  173973. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_1_I2": {
  173974. "hide_name": 0,
  173975. "bits": [ 1513, 1378, 1897, 1380 ],
  173976. "attributes": {
  173977. "force_downto": "00000000000000000000000000000001",
  173978. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173979. }
  173980. },
  173981. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  173982. "hide_name": 0,
  173983. "bits": [ 1898 ],
  173984. "attributes": {
  173985. "abc9_carry": "00000000000000000000000000000001",
  173986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  173987. }
  173988. },
  173989. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_16_I1_SB_LUT4_O_I2": {
  173990. "hide_name": 0,
  173991. "bits": [ 1895, 1896, 1375 ],
  173992. "attributes": {
  173993. "force_downto": "00000000000000000000000000000001",
  173994. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  173995. }
  173996. },
  173997. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1": {
  173998. "hide_name": 0,
  173999. "bits": [ 1367, 1899, 1900, 1901 ],
  174000. "attributes": {
  174001. "force_downto": "00000000000000000000000000000001",
  174002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174003. }
  174004. },
  174005. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_1_I2": {
  174006. "hide_name": 0,
  174007. "bits": [ 1511, 1378, 1904, 1380 ],
  174008. "attributes": {
  174009. "force_downto": "00000000000000000000000000000001",
  174010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174011. }
  174012. },
  174013. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174014. "hide_name": 0,
  174015. "bits": [ 1905 ],
  174016. "attributes": {
  174017. "abc9_carry": "00000000000000000000000000000001",
  174018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174019. }
  174020. },
  174021. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_17_I1_SB_LUT4_O_I2": {
  174022. "hide_name": 0,
  174023. "bits": [ 1902, 1903, 1375 ],
  174024. "attributes": {
  174025. "force_downto": "00000000000000000000000000000001",
  174026. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174027. }
  174028. },
  174029. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1": {
  174030. "hide_name": 0,
  174031. "bits": [ 1367, 1906, 1907, 1908 ],
  174032. "attributes": {
  174033. "force_downto": "00000000000000000000000000000001",
  174034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174035. }
  174036. },
  174037. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_1_I3": {
  174038. "hide_name": 0,
  174039. "bits": [ 1507, 1378, 1380, 1911 ],
  174040. "attributes": {
  174041. "force_downto": "00000000000000000000000000000001",
  174042. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174043. }
  174044. },
  174045. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  174046. "hide_name": 0,
  174047. "bits": [ 1912 ],
  174048. "attributes": {
  174049. "abc9_carry": "00000000000000000000000000000001",
  174050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174051. }
  174052. },
  174053. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_18_I1_SB_LUT4_O_I2": {
  174054. "hide_name": 0,
  174055. "bits": [ 1909, 1910, 1375 ],
  174056. "attributes": {
  174057. "force_downto": "00000000000000000000000000000001",
  174058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174059. }
  174060. },
  174061. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1": {
  174062. "hide_name": 0,
  174063. "bits": [ 1367, 1913, 1914, 1915 ],
  174064. "attributes": {
  174065. "force_downto": "00000000000000000000000000000001",
  174066. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174067. }
  174068. },
  174069. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_1_I3": {
  174070. "hide_name": 0,
  174071. "bits": [ 1485, 1378, 1380, 1918 ],
  174072. "attributes": {
  174073. "force_downto": "00000000000000000000000000000001",
  174074. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174075. }
  174076. },
  174077. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  174078. "hide_name": 0,
  174079. "bits": [ 1919 ],
  174080. "attributes": {
  174081. "abc9_carry": "00000000000000000000000000000001",
  174082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174083. }
  174084. },
  174085. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_19_I1_SB_LUT4_O_I2": {
  174086. "hide_name": 0,
  174087. "bits": [ 1916, 1917, 1375 ],
  174088. "attributes": {
  174089. "force_downto": "00000000000000000000000000000001",
  174090. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174091. }
  174092. },
  174093. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2": {
  174094. "hide_name": 0,
  174095. "bits": [ 1846, 1367, 1847, 1848 ],
  174096. "attributes": {
  174097. "force_downto": "00000000000000000000000000000001",
  174098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174099. }
  174100. },
  174101. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2": {
  174102. "hide_name": 0,
  174103. "bits": [ 1505, 1378, 1922, 1380 ],
  174104. "attributes": {
  174105. "force_downto": "00000000000000000000000000000001",
  174106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174107. }
  174108. },
  174109. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174110. "hide_name": 0,
  174111. "bits": [ 1923 ],
  174112. "attributes": {
  174113. "abc9_carry": "00000000000000000000000000000001",
  174114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174115. }
  174116. },
  174117. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  174118. "hide_name": 0,
  174119. "bits": [ 1924 ],
  174120. "attributes": {
  174121. "abc9_carry": "00000000000000000000000000000001",
  174122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174123. }
  174124. },
  174125. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O": {
  174126. "hide_name": 0,
  174127. "bits": [ 1509, 1378, 1819, 1380 ],
  174128. "attributes": {
  174129. "force_downto": "00000000000000000000000000000001",
  174130. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174131. }
  174132. },
  174133. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_1_I2_SB_LUT4_O_I2": {
  174134. "hide_name": 0,
  174135. "bits": [ 1920, 1921, 1375 ],
  174136. "attributes": {
  174137. "force_downto": "00000000000000000000000000000001",
  174138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174139. }
  174140. },
  174141. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1": {
  174142. "hide_name": 0,
  174143. "bits": [ 1367, 1928, 1929, 1930 ],
  174144. "attributes": {
  174145. "force_downto": "00000000000000000000000000000001",
  174146. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174147. }
  174148. },
  174149. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_1_I3": {
  174150. "hide_name": 0,
  174151. "bits": [ 1483, 1378, 1380, 1933 ],
  174152. "attributes": {
  174153. "force_downto": "00000000000000000000000000000001",
  174154. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174155. }
  174156. },
  174157. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  174158. "hide_name": 0,
  174159. "bits": [ 1934 ],
  174160. "attributes": {
  174161. "abc9_carry": "00000000000000000000000000000001",
  174162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174163. }
  174164. },
  174165. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_20_I1_SB_LUT4_O_I2": {
  174166. "hide_name": 0,
  174167. "bits": [ 1931, 1932, 1375 ],
  174168. "attributes": {
  174169. "force_downto": "00000000000000000000000000000001",
  174170. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174171. }
  174172. },
  174173. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2": {
  174174. "hide_name": 0,
  174175. "bits": [ 1925, 1367, 1926, 1927 ],
  174176. "attributes": {
  174177. "force_downto": "00000000000000000000000000000001",
  174178. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174179. }
  174180. },
  174181. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_1_I2": {
  174182. "hide_name": 0,
  174183. "bits": [ 1503, 1378, 1937, 1380 ],
  174184. "attributes": {
  174185. "force_downto": "00000000000000000000000000000001",
  174186. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174187. }
  174188. },
  174189. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174190. "hide_name": 0,
  174191. "bits": [ 1938 ],
  174192. "attributes": {
  174193. "abc9_carry": "00000000000000000000000000000001",
  174194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174195. }
  174196. },
  174197. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_2_I2_SB_LUT4_O_I2": {
  174198. "hide_name": 0,
  174199. "bits": [ 1935, 1936, 1375 ],
  174200. "attributes": {
  174201. "force_downto": "00000000000000000000000000000001",
  174202. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174203. }
  174204. },
  174205. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2": {
  174206. "hide_name": 0,
  174207. "bits": [ 1939, 1367, 1940, 1941 ],
  174208. "attributes": {
  174209. "force_downto": "00000000000000000000000000000001",
  174210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174211. }
  174212. },
  174213. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_1_I2": {
  174214. "hide_name": 0,
  174215. "bits": [ 1501, 1378, 1944, 1380 ],
  174216. "attributes": {
  174217. "force_downto": "00000000000000000000000000000001",
  174218. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174219. }
  174220. },
  174221. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174222. "hide_name": 0,
  174223. "bits": [ 1945 ],
  174224. "attributes": {
  174225. "abc9_carry": "00000000000000000000000000000001",
  174226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174227. }
  174228. },
  174229. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_3_I2_SB_LUT4_O_I2": {
  174230. "hide_name": 0,
  174231. "bits": [ 1942, 1943, 1375 ],
  174232. "attributes": {
  174233. "force_downto": "00000000000000000000000000000001",
  174234. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174235. }
  174236. },
  174237. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2": {
  174238. "hide_name": 0,
  174239. "bits": [ 1946, 1367, 1947, 1948 ],
  174240. "attributes": {
  174241. "force_downto": "00000000000000000000000000000001",
  174242. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174243. }
  174244. },
  174245. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_1_I2": {
  174246. "hide_name": 0,
  174247. "bits": [ 1499, 1378, 1951, 1380 ],
  174248. "attributes": {
  174249. "force_downto": "00000000000000000000000000000001",
  174250. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174251. }
  174252. },
  174253. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174254. "hide_name": 0,
  174255. "bits": [ 1952 ],
  174256. "attributes": {
  174257. "abc9_carry": "00000000000000000000000000000001",
  174258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174259. }
  174260. },
  174261. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_4_I2_SB_LUT4_O_I2": {
  174262. "hide_name": 0,
  174263. "bits": [ 1949, 1950, 1375 ],
  174264. "attributes": {
  174265. "force_downto": "00000000000000000000000000000001",
  174266. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174267. }
  174268. },
  174269. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2": {
  174270. "hide_name": 0,
  174271. "bits": [ 1953, 1367, 1954, 1955 ],
  174272. "attributes": {
  174273. "force_downto": "00000000000000000000000000000001",
  174274. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174275. }
  174276. },
  174277. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_1_I2": {
  174278. "hide_name": 0,
  174279. "bits": [ 1497, 1378, 1958, 1380 ],
  174280. "attributes": {
  174281. "force_downto": "00000000000000000000000000000001",
  174282. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174283. }
  174284. },
  174285. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174286. "hide_name": 0,
  174287. "bits": [ 1959 ],
  174288. "attributes": {
  174289. "abc9_carry": "00000000000000000000000000000001",
  174290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174291. }
  174292. },
  174293. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_5_I2_SB_LUT4_O_I2": {
  174294. "hide_name": 0,
  174295. "bits": [ 1956, 1957, 1375 ],
  174296. "attributes": {
  174297. "force_downto": "00000000000000000000000000000001",
  174298. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174299. }
  174300. },
  174301. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2": {
  174302. "hide_name": 0,
  174303. "bits": [ 1960, 1367, 1961, 1962 ],
  174304. "attributes": {
  174305. "force_downto": "00000000000000000000000000000001",
  174306. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174307. }
  174308. },
  174309. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_1_I2": {
  174310. "hide_name": 0,
  174311. "bits": [ 1495, 1378, 1965, 1380 ],
  174312. "attributes": {
  174313. "force_downto": "00000000000000000000000000000001",
  174314. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174315. }
  174316. },
  174317. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174318. "hide_name": 0,
  174319. "bits": [ 1966 ],
  174320. "attributes": {
  174321. "abc9_carry": "00000000000000000000000000000001",
  174322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174323. }
  174324. },
  174325. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_6_I2_SB_LUT4_O_I2": {
  174326. "hide_name": 0,
  174327. "bits": [ 1963, 1964, 1375 ],
  174328. "attributes": {
  174329. "force_downto": "00000000000000000000000000000001",
  174330. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174331. }
  174332. },
  174333. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2": {
  174334. "hide_name": 0,
  174335. "bits": [ 1967, 1367, 1968, 1969 ],
  174336. "attributes": {
  174337. "force_downto": "00000000000000000000000000000001",
  174338. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174339. }
  174340. },
  174341. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_1_I2": {
  174342. "hide_name": 0,
  174343. "bits": [ 1493, 1378, 1972, 1380 ],
  174344. "attributes": {
  174345. "force_downto": "00000000000000000000000000000001",
  174346. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174347. }
  174348. },
  174349. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174350. "hide_name": 0,
  174351. "bits": [ 1973 ],
  174352. "attributes": {
  174353. "abc9_carry": "00000000000000000000000000000001",
  174354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174355. }
  174356. },
  174357. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_7_I2_SB_LUT4_O_I2": {
  174358. "hide_name": 0,
  174359. "bits": [ 1970, 1971, 1375 ],
  174360. "attributes": {
  174361. "force_downto": "00000000000000000000000000000001",
  174362. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174363. }
  174364. },
  174365. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2": {
  174366. "hide_name": 0,
  174367. "bits": [ 1974, 1367, 1975, 1976 ],
  174368. "attributes": {
  174369. "force_downto": "00000000000000000000000000000001",
  174370. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174371. }
  174372. },
  174373. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_1_I2": {
  174374. "hide_name": 0,
  174375. "bits": [ 1491, 1378, 1979, 1380 ],
  174376. "attributes": {
  174377. "force_downto": "00000000000000000000000000000001",
  174378. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174379. }
  174380. },
  174381. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174382. "hide_name": 0,
  174383. "bits": [ 1980 ],
  174384. "attributes": {
  174385. "abc9_carry": "00000000000000000000000000000001",
  174386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174387. }
  174388. },
  174389. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_8_I2_SB_LUT4_O_I2": {
  174390. "hide_name": 0,
  174391. "bits": [ 1977, 1978, 1375 ],
  174392. "attributes": {
  174393. "force_downto": "00000000000000000000000000000001",
  174394. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174395. }
  174396. },
  174397. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2": {
  174398. "hide_name": 0,
  174399. "bits": [ 1981, 1367, 1982, 1983 ],
  174400. "attributes": {
  174401. "force_downto": "00000000000000000000000000000001",
  174402. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174403. }
  174404. },
  174405. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_1_I2": {
  174406. "hide_name": 0,
  174407. "bits": [ 1489, 1378, 1986, 1380 ],
  174408. "attributes": {
  174409. "force_downto": "00000000000000000000000000000001",
  174410. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174411. }
  174412. },
  174413. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  174414. "hide_name": 0,
  174415. "bits": [ 1856 ],
  174416. "attributes": {
  174417. "abc9_carry": "00000000000000000000000000000001",
  174418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:2947.36-2947.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174419. }
  174420. },
  174421. "cpu_I.IBusCachedPlugin_fetchPc_pc_SB_LUT4_O_9_I2_SB_LUT4_O_I2": {
  174422. "hide_name": 0,
  174423. "bits": [ 1984, 1985, 1375 ],
  174424. "attributes": {
  174425. "force_downto": "00000000000000000000000000000001",
  174426. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174427. }
  174428. },
  174429. "cpu_I.IBusCachedPlugin_fetchPc_redo_payload": {
  174430. "hide_name": 0,
  174431. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  174432. "attributes": {
  174433. "hdlname": "cpu_I IBusCachedPlugin_fetchPc_redo_payload",
  174434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:981.23-981.60"
  174435. }
  174436. },
  174437. "cpu_I.IBusCachedPlugin_fetchPc_redo_valid": {
  174438. "hide_name": 0,
  174439. "bits": [ 1378 ],
  174440. "attributes": {
  174441. "hdlname": "cpu_I IBusCachedPlugin_fetchPc_redo_valid",
  174442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:980.23-980.58"
  174443. }
  174444. },
  174445. "cpu_I.IBusCachedPlugin_iBusRsp_output_payload_pc": {
  174446. "hide_name": 0,
  174447. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  174448. "attributes": {
  174449. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_output_payload_pc",
  174450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1018.23-1018.65"
  174451. }
  174452. },
  174453. "cpu_I.IBusCachedPlugin_iBusRsp_output_payload_rsp_inst": {
  174454. "hide_name": 0,
  174455. "bits": [ 1545, 1544, 2328, 1364, 1543, 2329, 1363, 2853, 1542, 1541, 1539, 1538, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1530, 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1821 ],
  174456. "attributes": {
  174457. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_output_payload_rsp_inst",
  174458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1020.23-1020.71"
  174459. }
  174460. },
  174461. "cpu_I.IBusCachedPlugin_iBusRsp_redoFetch": {
  174462. "hide_name": 0,
  174463. "bits": [ 1378 ],
  174464. "attributes": {
  174465. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_redoFetch",
  174466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:983.23-983.57"
  174467. }
  174468. },
  174469. "cpu_I.IBusCachedPlugin_iBusRsp_stages_0_input_payload": {
  174470. "hide_name": 0,
  174471. "bits": [ "0", "0", 1439, 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1836, 1835, 1834, 1833, 1832, 1831, 1830, 1829, 1828, 1827, 1844, 1843, 1842, 1841, 1840, 1839, 1838, 1837, 1826, 1825, 1553 ],
  174472. "attributes": {
  174473. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_0_input_payload",
  174474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:986.23-986.70"
  174475. }
  174476. },
  174477. "cpu_I.IBusCachedPlugin_iBusRsp_stages_0_output_payload": {
  174478. "hide_name": 0,
  174479. "bits": [ "0", "0", 1439, 1453, 1443, 1419, 1410, 1400, 1387, 1372, 1369, 1836, 1835, 1834, 1833, 1832, 1831, 1830, 1829, 1828, 1827, 1844, 1843, 1842, 1841, 1840, 1839, 1838, 1837, 1826, 1825, 1553 ],
  174480. "attributes": {
  174481. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_0_output_payload",
  174482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:989.23-989.71"
  174483. }
  174484. },
  174485. "cpu_I.IBusCachedPlugin_iBusRsp_stages_0_output_ready": {
  174486. "hide_name": 0,
  174487. "bits": [ 1472 ],
  174488. "attributes": {
  174489. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_0_output_ready",
  174490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:988.23-988.69"
  174491. }
  174492. },
  174493. "cpu_I.IBusCachedPlugin_iBusRsp_stages_1_halt": {
  174494. "hide_name": 0,
  174495. "bits": [ "0" ],
  174496. "attributes": {
  174497. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_1_halt",
  174498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:997.23-997.61"
  174499. }
  174500. },
  174501. "cpu_I.IBusCachedPlugin_iBusRsp_stages_1_input_payload": {
  174502. "hide_name": 0,
  174503. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  174504. "attributes": {
  174505. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_1_input_payload",
  174506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:993.23-993.70"
  174507. }
  174508. },
  174509. "cpu_I.IBusCachedPlugin_iBusRsp_stages_1_input_ready": {
  174510. "hide_name": 0,
  174511. "bits": [ 1472 ],
  174512. "attributes": {
  174513. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_1_input_ready",
  174514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:992.23-992.68"
  174515. }
  174516. },
  174517. "cpu_I.IBusCachedPlugin_iBusRsp_stages_1_output_payload": {
  174518. "hide_name": 0,
  174519. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  174520. "attributes": {
  174521. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_1_output_payload",
  174522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:996.23-996.71"
  174523. }
  174524. },
  174525. "cpu_I.IBusCachedPlugin_iBusRsp_stages_1_output_ready": {
  174526. "hide_name": 0,
  174527. "bits": [ 1472 ],
  174528. "attributes": {
  174529. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_1_output_ready",
  174530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:995.23-995.69"
  174531. }
  174532. },
  174533. "cpu_I.IBusCachedPlugin_iBusRsp_stages_2_halt": {
  174534. "hide_name": 0,
  174535. "bits": [ 1378 ],
  174536. "attributes": {
  174537. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_2_halt",
  174538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1004.23-1004.61"
  174539. }
  174540. },
  174541. "cpu_I.IBusCachedPlugin_iBusRsp_stages_2_input_payload": {
  174542. "hide_name": 0,
  174543. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  174544. "attributes": {
  174545. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_2_input_payload",
  174546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1000.23-1000.70"
  174547. }
  174548. },
  174549. "cpu_I.IBusCachedPlugin_iBusRsp_stages_2_input_ready": {
  174550. "hide_name": 0,
  174551. "bits": [ 1472 ],
  174552. "attributes": {
  174553. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_2_input_ready",
  174554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:999.23-999.68"
  174555. }
  174556. },
  174557. "cpu_I.IBusCachedPlugin_iBusRsp_stages_2_output_payload": {
  174558. "hide_name": 0,
  174559. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  174560. "attributes": {
  174561. "hdlname": "cpu_I IBusCachedPlugin_iBusRsp_stages_2_output_payload",
  174562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1003.23-1003.71"
  174563. }
  174564. },
  174565. "cpu_I.IBusCachedPlugin_jump_pcLoad_payload": {
  174566. "hide_name": 0,
  174567. "bits": [ "x", "x", 7022, 7023, 7024, 7025, 7026, 7027, 7028, 7029, 7030, 7031, 7032, 7033, 7034, 7035, 7036, 7037, 7038, 7039, 7040, 7041, 7042, 7043, 7044, 7045, 7046, 7047, 7048, 7049, 7050, 7051 ],
  174568. "attributes": {
  174569. "hdlname": "cpu_I IBusCachedPlugin_jump_pcLoad_payload",
  174570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:963.23-963.59",
  174571. "unused_bits": "2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31"
  174572. }
  174573. },
  174574. "cpu_I.IBusCachedPlugin_mmuBus_busy": {
  174575. "hide_name": 0,
  174576. "bits": [ "0" ],
  174577. "attributes": {
  174578. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_busy",
  174579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:924.23-924.51"
  174580. }
  174581. },
  174582. "cpu_I.IBusCachedPlugin_mmuBus_cmd_bypassTranslation": {
  174583. "hide_name": 0,
  174584. "bits": [ "0" ],
  174585. "attributes": {
  174586. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_cmd_bypassTranslation",
  174587. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:915.23-915.68"
  174588. }
  174589. },
  174590. "cpu_I.IBusCachedPlugin_mmuBus_cmd_virtualAddress": {
  174591. "hide_name": 0,
  174592. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  174593. "attributes": {
  174594. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_cmd_virtualAddress",
  174595. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:914.23-914.65"
  174596. }
  174597. },
  174598. "cpu_I.IBusCachedPlugin_mmuBus_rsp_allowExecute": {
  174599. "hide_name": 0,
  174600. "bits": [ "1" ],
  174601. "attributes": {
  174602. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_allowExecute",
  174603. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:920.23-920.63"
  174604. }
  174605. },
  174606. "cpu_I.IBusCachedPlugin_mmuBus_rsp_allowRead": {
  174607. "hide_name": 0,
  174608. "bits": [ "1" ],
  174609. "attributes": {
  174610. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_allowRead",
  174611. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:918.23-918.60"
  174612. }
  174613. },
  174614. "cpu_I.IBusCachedPlugin_mmuBus_rsp_allowWrite": {
  174615. "hide_name": 0,
  174616. "bits": [ "1" ],
  174617. "attributes": {
  174618. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_allowWrite",
  174619. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:919.23-919.61"
  174620. }
  174621. },
  174622. "cpu_I.IBusCachedPlugin_mmuBus_rsp_exception": {
  174623. "hide_name": 0,
  174624. "bits": [ "0" ],
  174625. "attributes": {
  174626. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_exception",
  174627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:921.23-921.60"
  174628. }
  174629. },
  174630. "cpu_I.IBusCachedPlugin_mmuBus_rsp_isIoAccess": {
  174631. "hide_name": 0,
  174632. "bits": [ 1482 ],
  174633. "attributes": {
  174634. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_isIoAccess",
  174635. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:917.23-917.61"
  174636. }
  174637. },
  174638. "cpu_I.IBusCachedPlugin_mmuBus_rsp_physicalAddress": {
  174639. "hide_name": 0,
  174640. "bits": [ "0", "0", 1464, 1449, 1427, 1424, 1407, 1397, 1384, 1381, 1434, 1508, 1504, 1502, 1500, 1498, 1496, 1494, 1492, 1490, 1488, 1486, 1522, 1520, 1518, 1516, 1514, 1512, 1510, 1506, 1484, 1482 ],
  174641. "attributes": {
  174642. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_physicalAddress",
  174643. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:916.23-916.66"
  174644. }
  174645. },
  174646. "cpu_I.IBusCachedPlugin_mmuBus_rsp_refilling": {
  174647. "hide_name": 0,
  174648. "bits": [ "0" ],
  174649. "attributes": {
  174650. "hdlname": "cpu_I IBusCachedPlugin_mmuBus_rsp_refilling",
  174651. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:922.23-922.60"
  174652. }
  174653. },
  174654. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload": {
  174655. "hide_name": 0,
  174656. "bits": [ "0", 1824, 1436, 1451, 1440, 1416, 1408, 1398, 1385, 1370, 1366, 1845, 1846, 1925, 1939, 1946, 1953, 1960, 1967, 1974, 1981, 1849, 1857, 1864, 1871, 1878, 1885, 1893, 1900, 1907, 1915, 1930 ],
  174657. "attributes": {
  174658. "hdlname": "cpu_I IBusCachedPlugin_predictionJumpInterface_payload",
  174659. "keep": "00000000000000000000000000000001",
  174660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:906.45-906.93",
  174661. "syn_keep": "00000000000000000000000000000001"
  174662. }
  174663. },
  174664. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_10_I3": {
  174665. "hide_name": 0,
  174666. "bits": [ 1990 ],
  174667. "attributes": {
  174668. "abc9_carry": "00000000000000000000000000000001",
  174669. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174670. }
  174671. },
  174672. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_11_I2": {
  174673. "hide_name": 0,
  174674. "bits": [ "0", 1461, 1993, "0" ],
  174675. "attributes": {
  174676. "force_downto": "00000000000000000000000000000001",
  174677. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174678. }
  174679. },
  174680. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_12_I3": {
  174681. "hide_name": 0,
  174682. "bits": [ 1995 ],
  174683. "attributes": {
  174684. "abc9_carry": "00000000000000000000000000000001",
  174685. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174686. }
  174687. },
  174688. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_13_I3": {
  174689. "hide_name": 0,
  174690. "bits": [ 1996 ],
  174691. "attributes": {
  174692. "abc9_carry": "00000000000000000000000000000001",
  174693. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174694. }
  174695. },
  174696. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_14_I3": {
  174697. "hide_name": 0,
  174698. "bits": [ 1997 ],
  174699. "attributes": {
  174700. "abc9_carry": "00000000000000000000000000000001",
  174701. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174702. }
  174703. },
  174704. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_15_I3": {
  174705. "hide_name": 0,
  174706. "bits": [ 1998 ],
  174707. "attributes": {
  174708. "abc9_carry": "00000000000000000000000000000001",
  174709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174710. }
  174711. },
  174712. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_16_I3": {
  174713. "hide_name": 0,
  174714. "bits": [ 1999 ],
  174715. "attributes": {
  174716. "abc9_carry": "00000000000000000000000000000001",
  174717. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174718. }
  174719. },
  174720. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_17_I3": {
  174721. "hide_name": 0,
  174722. "bits": [ 2000 ],
  174723. "attributes": {
  174724. "abc9_carry": "00000000000000000000000000000001",
  174725. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174726. }
  174727. },
  174728. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_18_I3": {
  174729. "hide_name": 0,
  174730. "bits": [ 2001 ],
  174731. "attributes": {
  174732. "abc9_carry": "00000000000000000000000000000001",
  174733. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174734. }
  174735. },
  174736. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_19_I3": {
  174737. "hide_name": 0,
  174738. "bits": [ 2002 ],
  174739. "attributes": {
  174740. "abc9_carry": "00000000000000000000000000000001",
  174741. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174742. }
  174743. },
  174744. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_1_I2": {
  174745. "hide_name": 0,
  174746. "bits": [ "0", 1509, 1988, 1989 ],
  174747. "attributes": {
  174748. "force_downto": "00000000000000000000000000000001",
  174749. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174750. }
  174751. },
  174752. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_1_I3": {
  174753. "hide_name": 0,
  174754. "bits": [ 1989 ],
  174755. "attributes": {
  174756. "abc9_carry": "00000000000000000000000000000001",
  174757. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174758. }
  174759. },
  174760. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_20_I3": {
  174761. "hide_name": 0,
  174762. "bits": [ 2006 ],
  174763. "attributes": {
  174764. "abc9_carry": "00000000000000000000000000000001",
  174765. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174766. }
  174767. },
  174768. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_21_I3": {
  174769. "hide_name": 0,
  174770. "bits": [ 2007 ],
  174771. "attributes": {
  174772. "abc9_carry": "00000000000000000000000000000001",
  174773. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174774. }
  174775. },
  174776. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_22_I2": {
  174777. "hide_name": 0,
  174778. "bits": [ "0", 1457, 2008, 2009 ],
  174779. "attributes": {
  174780. "force_downto": "00000000000000000000000000000001",
  174781. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174782. }
  174783. },
  174784. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_22_I3": {
  174785. "hide_name": 0,
  174786. "bits": [ 2009 ],
  174787. "attributes": {
  174788. "abc9_carry": "00000000000000000000000000000001",
  174789. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174790. }
  174791. },
  174792. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_23_I2": {
  174793. "hide_name": 0,
  174794. "bits": [ "0", 1446, 2010, 2011 ],
  174795. "attributes": {
  174796. "force_downto": "00000000000000000000000000000001",
  174797. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174798. }
  174799. },
  174800. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_23_I3": {
  174801. "hide_name": 0,
  174802. "bits": [ 2011 ],
  174803. "attributes": {
  174804. "abc9_carry": "00000000000000000000000000000001",
  174805. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174806. }
  174807. },
  174808. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_24_I3": {
  174809. "hide_name": 0,
  174810. "bits": [ 2012 ],
  174811. "attributes": {
  174812. "abc9_carry": "00000000000000000000000000000001",
  174813. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174814. }
  174815. },
  174816. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_25_I3": {
  174817. "hide_name": 0,
  174818. "bits": [ 2013 ],
  174819. "attributes": {
  174820. "abc9_carry": "00000000000000000000000000000001",
  174821. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174822. }
  174823. },
  174824. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_26_I3": {
  174825. "hide_name": 0,
  174826. "bits": [ 2014 ],
  174827. "attributes": {
  174828. "abc9_carry": "00000000000000000000000000000001",
  174829. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174830. }
  174831. },
  174832. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_27_I3": {
  174833. "hide_name": 0,
  174834. "bits": [ 2015 ],
  174835. "attributes": {
  174836. "abc9_carry": "00000000000000000000000000000001",
  174837. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174838. }
  174839. },
  174840. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_28_I3": {
  174841. "hide_name": 0,
  174842. "bits": [ 2016 ],
  174843. "attributes": {
  174844. "abc9_carry": "00000000000000000000000000000001",
  174845. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174846. }
  174847. },
  174848. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_29_I3": {
  174849. "hide_name": 0,
  174850. "bits": [ 2003 ],
  174851. "attributes": {
  174852. "abc9_carry": "00000000000000000000000000000001",
  174853. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174854. }
  174855. },
  174856. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_2_I2": {
  174857. "hide_name": 0,
  174858. "bits": [ "0", 1505, 2004, 2005 ],
  174859. "attributes": {
  174860. "force_downto": "00000000000000000000000000000001",
  174861. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174862. }
  174863. },
  174864. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_2_I3": {
  174865. "hide_name": 0,
  174866. "bits": [ 2005 ],
  174867. "attributes": {
  174868. "abc9_carry": "00000000000000000000000000000001",
  174869. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174870. }
  174871. },
  174872. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_3_I2": {
  174873. "hide_name": 0,
  174874. "bits": [ "0", 1503, 2017, 2018 ],
  174875. "attributes": {
  174876. "force_downto": "00000000000000000000000000000001",
  174877. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174878. }
  174879. },
  174880. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_3_I3": {
  174881. "hide_name": 0,
  174882. "bits": [ 2018 ],
  174883. "attributes": {
  174884. "abc9_carry": "00000000000000000000000000000001",
  174885. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174886. }
  174887. },
  174888. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_4_I2": {
  174889. "hide_name": 0,
  174890. "bits": [ "0", 1501, 2019, 2020 ],
  174891. "attributes": {
  174892. "force_downto": "00000000000000000000000000000001",
  174893. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174894. }
  174895. },
  174896. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_4_I3": {
  174897. "hide_name": 0,
  174898. "bits": [ 2020 ],
  174899. "attributes": {
  174900. "abc9_carry": "00000000000000000000000000000001",
  174901. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174902. }
  174903. },
  174904. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_5_I2": {
  174905. "hide_name": 0,
  174906. "bits": [ "0", 1499, 2021, 2022 ],
  174907. "attributes": {
  174908. "force_downto": "00000000000000000000000000000001",
  174909. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174910. }
  174911. },
  174912. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_5_I3": {
  174913. "hide_name": 0,
  174914. "bits": [ 2022 ],
  174915. "attributes": {
  174916. "abc9_carry": "00000000000000000000000000000001",
  174917. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174918. }
  174919. },
  174920. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_6_I2": {
  174921. "hide_name": 0,
  174922. "bits": [ "0", 1497, 2023, 2024 ],
  174923. "attributes": {
  174924. "force_downto": "00000000000000000000000000000001",
  174925. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174926. }
  174927. },
  174928. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_6_I3": {
  174929. "hide_name": 0,
  174930. "bits": [ 2024 ],
  174931. "attributes": {
  174932. "abc9_carry": "00000000000000000000000000000001",
  174933. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174934. }
  174935. },
  174936. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_7_I2": {
  174937. "hide_name": 0,
  174938. "bits": [ "0", 1495, 2025, 2026 ],
  174939. "attributes": {
  174940. "force_downto": "00000000000000000000000000000001",
  174941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174942. }
  174943. },
  174944. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_7_I3": {
  174945. "hide_name": 0,
  174946. "bits": [ 2026 ],
  174947. "attributes": {
  174948. "abc9_carry": "00000000000000000000000000000001",
  174949. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174950. }
  174951. },
  174952. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_8_I2": {
  174953. "hide_name": 0,
  174954. "bits": [ "0", 1493, 2027, 2028 ],
  174955. "attributes": {
  174956. "force_downto": "00000000000000000000000000000001",
  174957. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174958. }
  174959. },
  174960. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_8_I3": {
  174961. "hide_name": 0,
  174962. "bits": [ 2028 ],
  174963. "attributes": {
  174964. "abc9_carry": "00000000000000000000000000000001",
  174965. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174966. }
  174967. },
  174968. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_9_I2": {
  174969. "hide_name": 0,
  174970. "bits": [ "0", 1491, 1992, 1991 ],
  174971. "attributes": {
  174972. "force_downto": "00000000000000000000000000000001",
  174973. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  174974. }
  174975. },
  174976. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_9_I3": {
  174977. "hide_name": 0,
  174978. "bits": [ 1991 ],
  174979. "attributes": {
  174980. "abc9_carry": "00000000000000000000000000000001",
  174981. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174982. }
  174983. },
  174984. "cpu_I.IBusCachedPlugin_predictionJumpInterface_payload_SB_LUT4_O_I3": {
  174985. "hide_name": 0,
  174986. "bits": [ 1987 ],
  174987. "attributes": {
  174988. "abc9_carry": "00000000000000000000000000000001",
  174989. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3156.62-3156.316|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  174990. }
  174991. },
  174992. "cpu_I.IBusCachedPlugin_rsp_iBusRspOutputHalt": {
  174993. "hide_name": 0,
  174994. "bits": [ "0" ],
  174995. "attributes": {
  174996. "hdlname": "cpu_I IBusCachedPlugin_rsp_iBusRspOutputHalt",
  174997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1050.23-1050.61"
  174998. }
  174999. },
  175000. "cpu_I.IBusCachedPlugin_rsp_issueDetected": {
  175001. "hide_name": 0,
  175002. "bits": [ "0" ],
  175003. "attributes": {
  175004. "hdlname": "cpu_I IBusCachedPlugin_rsp_issueDetected",
  175005. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1051.23-1051.57"
  175006. }
  175007. },
  175008. "cpu_I.IBusCachedPlugin_rsp_redoFetch": {
  175009. "hide_name": 0,
  175010. "bits": [ 1378 ],
  175011. "attributes": {
  175012. "hdlname": "cpu_I IBusCachedPlugin_rsp_redoFetch",
  175013. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1052.23-1052.53"
  175014. }
  175015. },
  175016. "cpu_I.IBusCachedPlugin_s0_tightlyCoupledHit": {
  175017. "hide_name": 0,
  175018. "bits": [ "0" ],
  175019. "attributes": {
  175020. "hdlname": "cpu_I IBusCachedPlugin_s0_tightlyCoupledHit",
  175021. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1047.23-1047.60"
  175022. }
  175023. },
  175024. "cpu_I.IBusCachedPlugin_s1_tightlyCoupledHit": {
  175025. "hide_name": 0,
  175026. "bits": [ "0" ],
  175027. "attributes": {
  175028. "hdlname": "cpu_I IBusCachedPlugin_s1_tightlyCoupledHit",
  175029. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1048.23-1048.60"
  175030. }
  175031. },
  175032. "cpu_I.IBusCachedPlugin_s2_tightlyCoupledHit": {
  175033. "hide_name": 0,
  175034. "bits": [ "0" ],
  175035. "attributes": {
  175036. "hdlname": "cpu_I IBusCachedPlugin_s2_tightlyCoupledHit",
  175037. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1049.23-1049.60"
  175038. }
  175039. },
  175040. "cpu_I.RegFilePlugin_regFile.0.0_RADDR": {
  175041. "hide_name": 0,
  175042. "bits": [ 2056, 2161, 2034, 2075 ],
  175043. "attributes": {
  175044. "force_downto": "00000000000000000000000000000001",
  175045. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175046. }
  175047. },
  175048. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_1": {
  175049. "hide_name": 0,
  175050. "bits": [ 2055, 2052, 2030, 2033 ],
  175051. "attributes": {
  175052. "force_downto": "00000000000000000000000000000001",
  175053. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175054. }
  175055. },
  175056. "cpu_I.RegFilePlugin_regFile.0.0_RADDR_2": {
  175057. "hide_name": 0,
  175058. "bits": [ 2054, 2053, 2031, 2032 ],
  175059. "attributes": {
  175060. "force_downto": "00000000000000000000000000000001",
  175061. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175062. }
  175063. },
  175064. "cpu_I.RegFilePlugin_regFile.0.0_RDATA": {
  175065. "hide_name": 0,
  175066. "bits": [ 2051, 2123, 2078 ],
  175067. "attributes": {
  175068. "force_downto": "00000000000000000000000000000001",
  175069. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175070. }
  175071. },
  175072. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_1": {
  175073. "hide_name": 0,
  175074. "bits": [ 2050, 2095, 2078 ],
  175075. "attributes": {
  175076. "force_downto": "00000000000000000000000000000001",
  175077. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175078. }
  175079. },
  175080. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_10": {
  175081. "hide_name": 0,
  175082. "bits": [ 2041, 2076, 2078 ],
  175083. "attributes": {
  175084. "force_downto": "00000000000000000000000000000001",
  175085. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175086. }
  175087. },
  175088. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_11": {
  175089. "hide_name": 0,
  175090. "bits": [ 2040, 2077, 2078 ],
  175091. "attributes": {
  175092. "force_downto": "00000000000000000000000000000001",
  175093. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175094. }
  175095. },
  175096. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_11_SB_LUT4_I1_O": {
  175097. "hide_name": 0,
  175098. "bits": [ 2063, 2079, 2080 ],
  175099. "attributes": {
  175100. "force_downto": "00000000000000000000000000000001",
  175101. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175102. }
  175103. },
  175104. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_11_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175105. "hide_name": 0,
  175106. "bits": [ 2112, 2291, 2081 ],
  175107. "attributes": {
  175108. "force_downto": "00000000000000000000000000000001",
  175109. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175110. }
  175111. },
  175112. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_12": {
  175113. "hide_name": 0,
  175114. "bits": [ 2039, 2082, 2078 ],
  175115. "attributes": {
  175116. "force_downto": "00000000000000000000000000000001",
  175117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175118. }
  175119. },
  175120. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_13": {
  175121. "hide_name": 0,
  175122. "bits": [ 2038, 2083, 2078 ],
  175123. "attributes": {
  175124. "force_downto": "00000000000000000000000000000001",
  175125. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175126. }
  175127. },
  175128. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_13_SB_LUT4_I1_O": {
  175129. "hide_name": 0,
  175130. "bits": [ 2061, 2084, 2080 ],
  175131. "attributes": {
  175132. "force_downto": "00000000000000000000000000000001",
  175133. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175134. }
  175135. },
  175136. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_13_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175137. "hide_name": 0,
  175138. "bits": [ 2289, 2112, 2085 ],
  175139. "attributes": {
  175140. "force_downto": "00000000000000000000000000000001",
  175141. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175142. }
  175143. },
  175144. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_14": {
  175145. "hide_name": 0,
  175146. "bits": [ 2037, 2086, 2078 ],
  175147. "attributes": {
  175148. "force_downto": "00000000000000000000000000000001",
  175149. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175150. }
  175151. },
  175152. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_15": {
  175153. "hide_name": 0,
  175154. "bits": [ 2036, 2087, 2078 ],
  175155. "attributes": {
  175156. "force_downto": "00000000000000000000000000000001",
  175157. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175158. }
  175159. },
  175160. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_15_SB_LUT4_I2_O": {
  175161. "hide_name": 0,
  175162. "bits": [ 2059, 2090, 2094 ],
  175163. "attributes": {
  175164. "force_downto": "00000000000000000000000000000001",
  175165. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175166. }
  175167. },
  175168. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_1_SB_LUT4_I1_O": {
  175169. "hide_name": 0,
  175170. "bits": [ 2073, 2096, 2080 ],
  175171. "attributes": {
  175172. "force_downto": "00000000000000000000000000000001",
  175173. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175174. }
  175175. },
  175176. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_1_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175177. "hide_name": 0,
  175178. "bits": [ 2112, 2286, 2097 ],
  175179. "attributes": {
  175180. "force_downto": "00000000000000000000000000000001",
  175181. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175182. }
  175183. },
  175184. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_2": {
  175185. "hide_name": 0,
  175186. "bits": [ 2049, 2098, 2078 ],
  175187. "attributes": {
  175188. "force_downto": "00000000000000000000000000000001",
  175189. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175190. }
  175191. },
  175192. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_2_SB_LUT4_I1_O": {
  175193. "hide_name": 0,
  175194. "bits": [ 2072, 2099, 2080 ],
  175195. "attributes": {
  175196. "force_downto": "00000000000000000000000000000001",
  175197. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175198. }
  175199. },
  175200. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_2_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175201. "hide_name": 0,
  175202. "bits": [ 3848, 2112, 2100, 2282 ],
  175203. "attributes": {
  175204. "force_downto": "00000000000000000000000000000001",
  175205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175206. }
  175207. },
  175208. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_3": {
  175209. "hide_name": 0,
  175210. "bits": [ 2048, 2101, 2078 ],
  175211. "attributes": {
  175212. "force_downto": "00000000000000000000000000000001",
  175213. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175214. }
  175215. },
  175216. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_3_SB_LUT4_I1_O": {
  175217. "hide_name": 0,
  175218. "bits": [ 2071, 2102, 2080 ],
  175219. "attributes": {
  175220. "force_downto": "00000000000000000000000000000001",
  175221. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175222. }
  175223. },
  175224. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_3_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175225. "hide_name": 0,
  175226. "bits": [ 2290, 2112, 2103 ],
  175227. "attributes": {
  175228. "force_downto": "00000000000000000000000000000001",
  175229. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175230. }
  175231. },
  175232. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_4": {
  175233. "hide_name": 0,
  175234. "bits": [ 2047, 2104, 2078 ],
  175235. "attributes": {
  175236. "force_downto": "00000000000000000000000000000001",
  175237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175238. }
  175239. },
  175240. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_4_SB_LUT4_I1_O": {
  175241. "hide_name": 0,
  175242. "bits": [ 2070, 2105, 2080 ],
  175243. "attributes": {
  175244. "force_downto": "00000000000000000000000000000001",
  175245. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175246. }
  175247. },
  175248. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175249. "hide_name": 0,
  175250. "bits": [ 3848, 2112, 2106, 2279 ],
  175251. "attributes": {
  175252. "force_downto": "00000000000000000000000000000001",
  175253. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175254. }
  175255. },
  175256. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_5": {
  175257. "hide_name": 0,
  175258. "bits": [ 2046, 2107, 2078 ],
  175259. "attributes": {
  175260. "force_downto": "00000000000000000000000000000001",
  175261. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175262. }
  175263. },
  175264. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_5_SB_LUT4_I1_O": {
  175265. "hide_name": 0,
  175266. "bits": [ 2069, 2108, 2080 ],
  175267. "attributes": {
  175268. "force_downto": "00000000000000000000000000000001",
  175269. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175270. }
  175271. },
  175272. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175273. "hide_name": 0,
  175274. "bits": [ 2112, 2288, 2109 ],
  175275. "attributes": {
  175276. "force_downto": "00000000000000000000000000000001",
  175277. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175278. }
  175279. },
  175280. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_6": {
  175281. "hide_name": 0,
  175282. "bits": [ 2045, 2110, 2078 ],
  175283. "attributes": {
  175284. "force_downto": "00000000000000000000000000000001",
  175285. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175286. }
  175287. },
  175288. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_6_SB_LUT4_I1_O": {
  175289. "hide_name": 0,
  175290. "bits": [ 2068, 2111, 2112, 2080 ],
  175291. "attributes": {
  175292. "force_downto": "00000000000000000000000000000001",
  175293. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175294. }
  175295. },
  175296. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_6_SB_LUT4_I1_O_SB_LUT4_I1_O": {
  175297. "hide_name": 0,
  175298. "bits": [ 2112, 2113, 2284 ],
  175299. "attributes": {
  175300. "force_downto": "00000000000000000000000000000001",
  175301. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175302. }
  175303. },
  175304. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_7": {
  175305. "hide_name": 0,
  175306. "bits": [ 2044, 2114, 2078 ],
  175307. "attributes": {
  175308. "force_downto": "00000000000000000000000000000001",
  175309. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175310. }
  175311. },
  175312. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_7_SB_LUT4_I1_O": {
  175313. "hide_name": 0,
  175314. "bits": [ 2067, 2115, 2080 ],
  175315. "attributes": {
  175316. "force_downto": "00000000000000000000000000000001",
  175317. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175318. }
  175319. },
  175320. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175321. "hide_name": 0,
  175322. "bits": [ 2112, 2293, 2116 ],
  175323. "attributes": {
  175324. "force_downto": "00000000000000000000000000000001",
  175325. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175326. }
  175327. },
  175328. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_8": {
  175329. "hide_name": 0,
  175330. "bits": [ 2043, 2117, 2078 ],
  175331. "attributes": {
  175332. "force_downto": "00000000000000000000000000000001",
  175333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175334. }
  175335. },
  175336. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_8_SB_LUT4_I1_O": {
  175337. "hide_name": 0,
  175338. "bits": [ 2066, 2118, 2080 ],
  175339. "attributes": {
  175340. "force_downto": "00000000000000000000000000000001",
  175341. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175342. }
  175343. },
  175344. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_8_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175345. "hide_name": 0,
  175346. "bits": [ 3848, 2112, 2119, 2278 ],
  175347. "attributes": {
  175348. "force_downto": "00000000000000000000000000000001",
  175349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175350. }
  175351. },
  175352. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_9": {
  175353. "hide_name": 0,
  175354. "bits": [ 2042, 2120, 2078 ],
  175355. "attributes": {
  175356. "force_downto": "00000000000000000000000000000001",
  175357. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175358. }
  175359. },
  175360. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_9_SB_LUT4_I1_O": {
  175361. "hide_name": 0,
  175362. "bits": [ 2065, 2121, 2080 ],
  175363. "attributes": {
  175364. "force_downto": "00000000000000000000000000000001",
  175365. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175366. }
  175367. },
  175368. "cpu_I.RegFilePlugin_regFile.0.0_RDATA_9_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175369. "hide_name": 0,
  175370. "bits": [ 2112, 2287, 2122 ],
  175371. "attributes": {
  175372. "force_downto": "00000000000000000000000000000001",
  175373. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175374. }
  175375. },
  175376. "cpu_I.RegFilePlugin_regFile.0.1_RDATA": {
  175377. "hide_name": 0,
  175378. "bits": [ 2139, 2188, 2078 ],
  175379. "attributes": {
  175380. "force_downto": "00000000000000000000000000000001",
  175381. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175382. }
  175383. },
  175384. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_1": {
  175385. "hide_name": 0,
  175386. "bits": [ 2138, 2171, 2078 ],
  175387. "attributes": {
  175388. "force_downto": "00000000000000000000000000000001",
  175389. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175390. }
  175391. },
  175392. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10": {
  175393. "hide_name": 0,
  175394. "bits": [ 2129, 2157, 2078 ],
  175395. "attributes": {
  175396. "force_downto": "00000000000000000000000000000001",
  175397. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175398. }
  175399. },
  175400. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_D": {
  175401. "hide_name": 0,
  175402. "bits": [ 2156 ],
  175403. "attributes": {
  175404. }
  175405. },
  175406. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_10_SB_DFF_Q_D_SB_LUT4_O_I1": {
  175407. "hide_name": 0,
  175408. "bits": [ 2158, 2159, 2160 ],
  175409. "attributes": {
  175410. "force_downto": "00000000000000000000000000000001",
  175411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175412. }
  175413. },
  175414. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_11": {
  175415. "hide_name": 0,
  175416. "bits": [ 2128, 2162, 2078 ],
  175417. "attributes": {
  175418. "force_downto": "00000000000000000000000000000001",
  175419. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175420. }
  175421. },
  175422. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_12": {
  175423. "hide_name": 0,
  175424. "bits": [ 2127, 2163, 2078 ],
  175425. "attributes": {
  175426. "force_downto": "00000000000000000000000000000001",
  175427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175428. }
  175429. },
  175430. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_13": {
  175431. "hide_name": 0,
  175432. "bits": [ 2126, 2164, 2078 ],
  175433. "attributes": {
  175434. "force_downto": "00000000000000000000000000000001",
  175435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175436. }
  175437. },
  175438. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_13_SB_LUT4_I1_O": {
  175439. "hide_name": 0,
  175440. "bits": [ 2142, 2165, 2080 ],
  175441. "attributes": {
  175442. "force_downto": "00000000000000000000000000000001",
  175443. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175444. }
  175445. },
  175446. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_13_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175447. "hide_name": 0,
  175448. "bits": [ 2112, 2166, 2272 ],
  175449. "attributes": {
  175450. "force_downto": "00000000000000000000000000000001",
  175451. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175452. }
  175453. },
  175454. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_14": {
  175455. "hide_name": 0,
  175456. "bits": [ 2125, 2167, 2078 ],
  175457. "attributes": {
  175458. "force_downto": "00000000000000000000000000000001",
  175459. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175460. }
  175461. },
  175462. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_15": {
  175463. "hide_name": 0,
  175464. "bits": [ 2124, 2168, 2078 ],
  175465. "attributes": {
  175466. "force_downto": "00000000000000000000000000000001",
  175467. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175468. }
  175469. },
  175470. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_15_SB_LUT4_I1_O": {
  175471. "hide_name": 0,
  175472. "bits": [ 2140, 2169, 2080 ],
  175473. "attributes": {
  175474. "force_downto": "00000000000000000000000000000001",
  175475. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175476. }
  175477. },
  175478. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_15_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175479. "hide_name": 0,
  175480. "bits": [ 2112, 2170, 2276 ],
  175481. "attributes": {
  175482. "force_downto": "00000000000000000000000000000001",
  175483. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175484. }
  175485. },
  175486. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_1_SB_LUT4_I1_O": {
  175487. "hide_name": 0,
  175488. "bits": [ 2154, 2172, 2080 ],
  175489. "attributes": {
  175490. "force_downto": "00000000000000000000000000000001",
  175491. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175492. }
  175493. },
  175494. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_1_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175495. "hide_name": 0,
  175496. "bits": [ 2112, 2173, 2299 ],
  175497. "attributes": {
  175498. "force_downto": "00000000000000000000000000000001",
  175499. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175500. }
  175501. },
  175502. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_2": {
  175503. "hide_name": 0,
  175504. "bits": [ 2137, 2174, 2078 ],
  175505. "attributes": {
  175506. "force_downto": "00000000000000000000000000000001",
  175507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175508. }
  175509. },
  175510. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_3": {
  175511. "hide_name": 0,
  175512. "bits": [ 2136, 2175, 2078 ],
  175513. "attributes": {
  175514. "force_downto": "00000000000000000000000000000001",
  175515. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175516. }
  175517. },
  175518. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_3_SB_LUT4_I1_O": {
  175519. "hide_name": 0,
  175520. "bits": [ 2152, 2176, 2080 ],
  175521. "attributes": {
  175522. "force_downto": "00000000000000000000000000000001",
  175523. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175524. }
  175525. },
  175526. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_3_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175527. "hide_name": 0,
  175528. "bits": [ 2112, 2177, 2273 ],
  175529. "attributes": {
  175530. "force_downto": "00000000000000000000000000000001",
  175531. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175532. }
  175533. },
  175534. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_4": {
  175535. "hide_name": 0,
  175536. "bits": [ 2135, 2178, 2078 ],
  175537. "attributes": {
  175538. "force_downto": "00000000000000000000000000000001",
  175539. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175540. }
  175541. },
  175542. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_5": {
  175543. "hide_name": 0,
  175544. "bits": [ 2134, 2179, 2078 ],
  175545. "attributes": {
  175546. "force_downto": "00000000000000000000000000000001",
  175547. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175548. }
  175549. },
  175550. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_6": {
  175551. "hide_name": 0,
  175552. "bits": [ 2133, 2180, 2078 ],
  175553. "attributes": {
  175554. "force_downto": "00000000000000000000000000000001",
  175555. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175556. }
  175557. },
  175558. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_7": {
  175559. "hide_name": 0,
  175560. "bits": [ 2132, 2181, 2078 ],
  175561. "attributes": {
  175562. "force_downto": "00000000000000000000000000000001",
  175563. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175564. }
  175565. },
  175566. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_8": {
  175567. "hide_name": 0,
  175568. "bits": [ 2131, 2182, 2078 ],
  175569. "attributes": {
  175570. "force_downto": "00000000000000000000000000000001",
  175571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175572. }
  175573. },
  175574. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_8_SB_LUT4_I1_O": {
  175575. "hide_name": 0,
  175576. "bits": [ 2147, 2183, 2080 ],
  175577. "attributes": {
  175578. "force_downto": "00000000000000000000000000000001",
  175579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175580. }
  175581. },
  175582. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_8_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175583. "hide_name": 0,
  175584. "bits": [ 3848, 2112, 2184, 2270 ],
  175585. "attributes": {
  175586. "force_downto": "00000000000000000000000000000001",
  175587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175588. }
  175589. },
  175590. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_9": {
  175591. "hide_name": 0,
  175592. "bits": [ 2130, 2185, 2078 ],
  175593. "attributes": {
  175594. "force_downto": "00000000000000000000000000000001",
  175595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175596. }
  175597. },
  175598. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_9_SB_LUT4_I1_O": {
  175599. "hide_name": 0,
  175600. "bits": [ 2146, 2186, 2080 ],
  175601. "attributes": {
  175602. "force_downto": "00000000000000000000000000000001",
  175603. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175604. }
  175605. },
  175606. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_9_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175607. "hide_name": 0,
  175608. "bits": [ 2112, 2187, 2300 ],
  175609. "attributes": {
  175610. "force_downto": "00000000000000000000000000000001",
  175611. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175612. }
  175613. },
  175614. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_SB_LUT4_I1_O": {
  175615. "hide_name": 0,
  175616. "bits": [ 2155, 2189, 2080 ],
  175617. "attributes": {
  175618. "force_downto": "00000000000000000000000000000001",
  175619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175620. }
  175621. },
  175622. "cpu_I.RegFilePlugin_regFile.0.1_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175623. "hide_name": 0,
  175624. "bits": [ 2112, 2190, 2269 ],
  175625. "attributes": {
  175626. "force_downto": "00000000000000000000000000000001",
  175627. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175628. }
  175629. },
  175630. "cpu_I.RegFilePlugin_regFile.1.0_RADDR": {
  175631. "hide_name": 0,
  175632. "bits": [ 2056, 2055, 2194, 2195 ],
  175633. "attributes": {
  175634. "force_downto": "00000000000000000000000000000001",
  175635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175636. }
  175637. },
  175638. "cpu_I.RegFilePlugin_regFile.1.0_RADDR_1": {
  175639. "hide_name": 0,
  175640. "bits": [ 2054, 2053, 2192, 2193 ],
  175641. "attributes": {
  175642. "force_downto": "00000000000000000000000000000001",
  175643. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175644. }
  175645. },
  175646. "cpu_I.RegFilePlugin_regFile.1.0_RDATA": {
  175647. "hide_name": 0,
  175648. "bits": [ 2210, 2123, 2089 ],
  175649. "attributes": {
  175650. "force_downto": "00000000000000000000000000000001",
  175651. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175652. }
  175653. },
  175654. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_1": {
  175655. "hide_name": 0,
  175656. "bits": [ 2209, 2095, 2089 ],
  175657. "attributes": {
  175658. "force_downto": "00000000000000000000000000000001",
  175659. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175660. }
  175661. },
  175662. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_10": {
  175663. "hide_name": 0,
  175664. "bits": [ 2200, 2076, 2089 ],
  175665. "attributes": {
  175666. "force_downto": "00000000000000000000000000000001",
  175667. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175668. }
  175669. },
  175670. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_10_SB_LUT4_I1_O": {
  175671. "hide_name": 0,
  175672. "bits": [ 2064, 2211, 2094 ],
  175673. "attributes": {
  175674. "force_downto": "00000000000000000000000000000001",
  175675. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175676. }
  175677. },
  175678. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_10_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175679. "hide_name": 0,
  175680. "bits": [ 3715, 2323, 2212, 2283 ],
  175681. "attributes": {
  175682. "force_downto": "00000000000000000000000000000001",
  175683. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175684. }
  175685. },
  175686. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_11": {
  175687. "hide_name": 0,
  175688. "bits": [ 2199, 2077, 2089 ],
  175689. "attributes": {
  175690. "force_downto": "00000000000000000000000000000001",
  175691. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175692. }
  175693. },
  175694. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_12": {
  175695. "hide_name": 0,
  175696. "bits": [ 2198, 2082, 2089 ],
  175697. "attributes": {
  175698. "force_downto": "00000000000000000000000000000001",
  175699. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175700. }
  175701. },
  175702. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_12_SB_LUT4_I1_O": {
  175703. "hide_name": 0,
  175704. "bits": [ 2062, 2213, 2094 ],
  175705. "attributes": {
  175706. "force_downto": "00000000000000000000000000000001",
  175707. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175708. }
  175709. },
  175710. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_12_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175711. "hide_name": 0,
  175712. "bits": [ 3715, 2323, 2214, 2280 ],
  175713. "attributes": {
  175714. "force_downto": "00000000000000000000000000000001",
  175715. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175716. }
  175717. },
  175718. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_13": {
  175719. "hide_name": 0,
  175720. "bits": [ 2197, 2083, 2089 ],
  175721. "attributes": {
  175722. "force_downto": "00000000000000000000000000000001",
  175723. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175724. }
  175725. },
  175726. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_14": {
  175727. "hide_name": 0,
  175728. "bits": [ 2196, 2086, 2089 ],
  175729. "attributes": {
  175730. "force_downto": "00000000000000000000000000000001",
  175731. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175732. }
  175733. },
  175734. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_14_SB_LUT4_I1_O": {
  175735. "hide_name": 0,
  175736. "bits": [ 2060, 2215, 2094 ],
  175737. "attributes": {
  175738. "force_downto": "00000000000000000000000000000001",
  175739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175740. }
  175741. },
  175742. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_14_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175743. "hide_name": 0,
  175744. "bits": [ 3715, 2323, 2216, 2285 ],
  175745. "attributes": {
  175746. "force_downto": "00000000000000000000000000000001",
  175747. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175748. }
  175749. },
  175750. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15": {
  175751. "hide_name": 0,
  175752. "bits": [ 2088, 2087, 2089 ],
  175753. "attributes": {
  175754. "force_downto": "00000000000000000000000000000001",
  175755. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175756. }
  175757. },
  175758. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q_D": {
  175759. "hide_name": 0,
  175760. "bits": [ 2217 ],
  175761. "attributes": {
  175762. }
  175763. },
  175764. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_15_SB_DFF_Q_D_SB_LUT4_O_I1": {
  175765. "hide_name": 0,
  175766. "bits": [ 2218, 2219, 2220 ],
  175767. "attributes": {
  175768. "force_downto": "00000000000000000000000000000001",
  175769. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175770. }
  175771. },
  175772. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_2": {
  175773. "hide_name": 0,
  175774. "bits": [ 2208, 2098, 2089 ],
  175775. "attributes": {
  175776. "force_downto": "00000000000000000000000000000001",
  175777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175778. }
  175779. },
  175780. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_3": {
  175781. "hide_name": 0,
  175782. "bits": [ 2207, 2101, 2089 ],
  175783. "attributes": {
  175784. "force_downto": "00000000000000000000000000000001",
  175785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175786. }
  175787. },
  175788. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_4": {
  175789. "hide_name": 0,
  175790. "bits": [ 2206, 2104, 2089 ],
  175791. "attributes": {
  175792. "force_downto": "00000000000000000000000000000001",
  175793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175794. }
  175795. },
  175796. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_5": {
  175797. "hide_name": 0,
  175798. "bits": [ 2205, 2107, 2089 ],
  175799. "attributes": {
  175800. "force_downto": "00000000000000000000000000000001",
  175801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175802. }
  175803. },
  175804. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_6": {
  175805. "hide_name": 0,
  175806. "bits": [ 2204, 2110, 2089 ],
  175807. "attributes": {
  175808. "force_downto": "00000000000000000000000000000001",
  175809. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175810. }
  175811. },
  175812. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_7": {
  175813. "hide_name": 0,
  175814. "bits": [ 2203, 2114, 2089 ],
  175815. "attributes": {
  175816. "force_downto": "00000000000000000000000000000001",
  175817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175818. }
  175819. },
  175820. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_8": {
  175821. "hide_name": 0,
  175822. "bits": [ 2202, 2117, 2089 ],
  175823. "attributes": {
  175824. "force_downto": "00000000000000000000000000000001",
  175825. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175826. }
  175827. },
  175828. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_9": {
  175829. "hide_name": 0,
  175830. "bits": [ 2201, 2120, 2089 ],
  175831. "attributes": {
  175832. "force_downto": "00000000000000000000000000000001",
  175833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175834. }
  175835. },
  175836. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_SB_LUT4_I1_O": {
  175837. "hide_name": 0,
  175838. "bits": [ 2074, 2222, 2094 ],
  175839. "attributes": {
  175840. "force_downto": "00000000000000000000000000000001",
  175841. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175842. }
  175843. },
  175844. "cpu_I.RegFilePlugin_regFile.1.0_RDATA_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175845. "hide_name": 0,
  175846. "bits": [ 3715, 2323, 2223, 2277 ],
  175847. "attributes": {
  175848. "force_downto": "00000000000000000000000000000001",
  175849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175850. }
  175851. },
  175852. "cpu_I.RegFilePlugin_regFile.1.1_RDATA": {
  175853. "hide_name": 0,
  175854. "bits": [ 2239, 2188, 2089 ],
  175855. "attributes": {
  175856. "force_downto": "00000000000000000000000000000001",
  175857. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175858. }
  175859. },
  175860. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_1": {
  175861. "hide_name": 0,
  175862. "bits": [ 2238, 2171, 2089 ],
  175863. "attributes": {
  175864. "force_downto": "00000000000000000000000000000001",
  175865. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175866. }
  175867. },
  175868. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_10": {
  175869. "hide_name": 0,
  175870. "bits": [ 2229, 2157, 2089 ],
  175871. "attributes": {
  175872. "force_downto": "00000000000000000000000000000001",
  175873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175874. }
  175875. },
  175876. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_10_SB_LUT4_I1_O": {
  175877. "hide_name": 0,
  175878. "bits": [ 2145, 2240, 2094 ],
  175879. "attributes": {
  175880. "force_downto": "00000000000000000000000000000001",
  175881. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175882. }
  175883. },
  175884. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_10_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175885. "hide_name": 0,
  175886. "bits": [ 2323, 2241, 2296 ],
  175887. "attributes": {
  175888. "force_downto": "00000000000000000000000000000001",
  175889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175890. }
  175891. },
  175892. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_11": {
  175893. "hide_name": 0,
  175894. "bits": [ 2228, 2162, 2089 ],
  175895. "attributes": {
  175896. "force_downto": "00000000000000000000000000000001",
  175897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175898. }
  175899. },
  175900. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_11_SB_LUT4_I1_O": {
  175901. "hide_name": 0,
  175902. "bits": [ 2144, 2242, 2094 ],
  175903. "attributes": {
  175904. "force_downto": "00000000000000000000000000000001",
  175905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175906. }
  175907. },
  175908. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_11_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175909. "hide_name": 0,
  175910. "bits": [ 2323, 2243, 2274 ],
  175911. "attributes": {
  175912. "force_downto": "00000000000000000000000000000001",
  175913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175914. }
  175915. },
  175916. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_12": {
  175917. "hide_name": 0,
  175918. "bits": [ 2227, 2163, 2089 ],
  175919. "attributes": {
  175920. "force_downto": "00000000000000000000000000000001",
  175921. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175922. }
  175923. },
  175924. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_12_SB_LUT4_I1_O": {
  175925. "hide_name": 0,
  175926. "bits": [ 2143, 2244, 2094 ],
  175927. "attributes": {
  175928. "force_downto": "00000000000000000000000000000001",
  175929. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175930. }
  175931. },
  175932. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_12_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175933. "hide_name": 0,
  175934. "bits": [ 2323, 2245, 2292 ],
  175935. "attributes": {
  175936. "force_downto": "00000000000000000000000000000001",
  175937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175938. }
  175939. },
  175940. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_13": {
  175941. "hide_name": 0,
  175942. "bits": [ 2226, 2164, 2089 ],
  175943. "attributes": {
  175944. "force_downto": "00000000000000000000000000000001",
  175945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175946. }
  175947. },
  175948. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_14": {
  175949. "hide_name": 0,
  175950. "bits": [ 2225, 2167, 2089 ],
  175951. "attributes": {
  175952. "force_downto": "00000000000000000000000000000001",
  175953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175954. }
  175955. },
  175956. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_14_SB_LUT4_I1_O": {
  175957. "hide_name": 0,
  175958. "bits": [ 2141, 2246, 2094 ],
  175959. "attributes": {
  175960. "force_downto": "00000000000000000000000000000001",
  175961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175962. }
  175963. },
  175964. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_14_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175965. "hide_name": 0,
  175966. "bits": [ 2323, 2247, 2298 ],
  175967. "attributes": {
  175968. "force_downto": "00000000000000000000000000000001",
  175969. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175970. }
  175971. },
  175972. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_15": {
  175973. "hide_name": 0,
  175974. "bits": [ 2224, 2168, 2089 ],
  175975. "attributes": {
  175976. "force_downto": "00000000000000000000000000000001",
  175977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175978. }
  175979. },
  175980. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_2": {
  175981. "hide_name": 0,
  175982. "bits": [ 2237, 2174, 2089 ],
  175983. "attributes": {
  175984. "force_downto": "00000000000000000000000000000001",
  175985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175986. }
  175987. },
  175988. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_2_SB_LUT4_I1_O": {
  175989. "hide_name": 0,
  175990. "bits": [ 2153, 2248, 2094 ],
  175991. "attributes": {
  175992. "force_downto": "00000000000000000000000000000001",
  175993. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  175994. }
  175995. },
  175996. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_2_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  175997. "hide_name": 0,
  175998. "bits": [ 2323, 2249, 2295 ],
  175999. "attributes": {
  176000. "force_downto": "00000000000000000000000000000001",
  176001. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176002. }
  176003. },
  176004. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_3": {
  176005. "hide_name": 0,
  176006. "bits": [ 2236, 2175, 2089 ],
  176007. "attributes": {
  176008. "force_downto": "00000000000000000000000000000001",
  176009. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176010. }
  176011. },
  176012. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_4": {
  176013. "hide_name": 0,
  176014. "bits": [ 2235, 2178, 2089 ],
  176015. "attributes": {
  176016. "force_downto": "00000000000000000000000000000001",
  176017. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176018. }
  176019. },
  176020. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_4_SB_LUT4_I1_O": {
  176021. "hide_name": 0,
  176022. "bits": [ 2151, 2250, 2094 ],
  176023. "attributes": {
  176024. "force_downto": "00000000000000000000000000000001",
  176025. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176026. }
  176027. },
  176028. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_4_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  176029. "hide_name": 0,
  176030. "bits": [ 2323, 2251, 2281 ],
  176031. "attributes": {
  176032. "force_downto": "00000000000000000000000000000001",
  176033. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176034. }
  176035. },
  176036. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_5": {
  176037. "hide_name": 0,
  176038. "bits": [ 2234, 2179, 2089 ],
  176039. "attributes": {
  176040. "force_downto": "00000000000000000000000000000001",
  176041. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176042. }
  176043. },
  176044. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_5_SB_LUT4_I1_O": {
  176045. "hide_name": 0,
  176046. "bits": [ 2150, 2252, 2094 ],
  176047. "attributes": {
  176048. "force_downto": "00000000000000000000000000000001",
  176049. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176050. }
  176051. },
  176052. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_5_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  176053. "hide_name": 0,
  176054. "bits": [ 2323, 2253, 2271 ],
  176055. "attributes": {
  176056. "force_downto": "00000000000000000000000000000001",
  176057. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176058. }
  176059. },
  176060. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_6": {
  176061. "hide_name": 0,
  176062. "bits": [ 2233, 2180, 2089 ],
  176063. "attributes": {
  176064. "force_downto": "00000000000000000000000000000001",
  176065. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176066. }
  176067. },
  176068. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_6_SB_LUT4_I1_O": {
  176069. "hide_name": 0,
  176070. "bits": [ 2149, 2254, 2094 ],
  176071. "attributes": {
  176072. "force_downto": "00000000000000000000000000000001",
  176073. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176074. }
  176075. },
  176076. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_6_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  176077. "hide_name": 0,
  176078. "bits": [ 2323, 2255, 2297 ],
  176079. "attributes": {
  176080. "force_downto": "00000000000000000000000000000001",
  176081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176082. }
  176083. },
  176084. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_7": {
  176085. "hide_name": 0,
  176086. "bits": [ 2232, 2181, 2089 ],
  176087. "attributes": {
  176088. "force_downto": "00000000000000000000000000000001",
  176089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176090. }
  176091. },
  176092. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_7_SB_LUT4_I1_O": {
  176093. "hide_name": 0,
  176094. "bits": [ 2148, 2256, 2094 ],
  176095. "attributes": {
  176096. "force_downto": "00000000000000000000000000000001",
  176097. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176098. }
  176099. },
  176100. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_7_SB_LUT4_I1_O_SB_LUT4_I2_O": {
  176101. "hide_name": 0,
  176102. "bits": [ 2323, 2257, 2275 ],
  176103. "attributes": {
  176104. "force_downto": "00000000000000000000000000000001",
  176105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176106. }
  176107. },
  176108. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_8": {
  176109. "hide_name": 0,
  176110. "bits": [ 2231, 2182, 2089 ],
  176111. "attributes": {
  176112. "force_downto": "00000000000000000000000000000001",
  176113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176114. }
  176115. },
  176116. "cpu_I.RegFilePlugin_regFile.1.1_RDATA_9": {
  176117. "hide_name": 0,
  176118. "bits": [ 2230, 2185, 2089 ],
  176119. "attributes": {
  176120. "force_downto": "00000000000000000000000000000001",
  176121. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176122. }
  176123. },
  176124. "cpu_I.RegFilePlugin_shadow_write": {
  176125. "hide_name": 0,
  176126. "bits": [ 2259 ],
  176127. "attributes": {
  176128. "hdlname": "cpu_I RegFilePlugin_shadow_write",
  176129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1086.23-1086.49"
  176130. }
  176131. },
  176132. "cpu_I.RegFilePlugin_shadow_write_SB_DFFR_Q_D": {
  176133. "hide_name": 0,
  176134. "bits": [ 2258 ],
  176135. "attributes": {
  176136. }
  176137. },
  176138. "cpu_I.RegFilePlugin_shadow_write_SB_DFF_D_Q": {
  176139. "hide_name": 0,
  176140. "bits": [ 2057, 2058, 2035 ],
  176141. "attributes": {
  176142. "force_downto": "00000000000000000000000000000001",
  176143. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176144. }
  176145. },
  176146. "cpu_I.RegFilePlugin_shadow_write_SB_DFF_D_Q_SB_LUT4_I1_O": {
  176147. "hide_name": 0,
  176148. "bits": [ 2052, 2161, 2191, 2221 ],
  176149. "attributes": {
  176150. "force_downto": "00000000000000000000000000000001",
  176151. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176152. }
  176153. },
  176154. "cpu_I._zz_100_": {
  176155. "hide_name": 0,
  176156. "bits": [ 1822, 1823 ],
  176157. "attributes": {
  176158. "hdlname": "cpu_I _zz_100_",
  176159. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1085.20-1085.28"
  176160. }
  176161. },
  176162. "cpu_I._zz_104_": {
  176163. "hide_name": 0,
  176164. "bits": [ 943 ],
  176165. "attributes": {
  176166. "hdlname": "cpu_I _zz_104_",
  176167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1100.23-1100.31"
  176168. }
  176169. },
  176170. "cpu_I._zz_105_": {
  176171. "hide_name": 0,
  176172. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176173. "attributes": {
  176174. "hdlname": "cpu_I _zz_105_",
  176175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1101.23-1101.31"
  176176. }
  176177. },
  176178. "cpu_I._zz_106_": {
  176179. "hide_name": 0,
  176180. "bits": [ 943 ],
  176181. "attributes": {
  176182. "hdlname": "cpu_I _zz_106_",
  176183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1102.23-1102.31"
  176184. }
  176185. },
  176186. "cpu_I._zz_107_": {
  176187. "hide_name": 0,
  176188. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176189. "attributes": {
  176190. "hdlname": "cpu_I _zz_107_",
  176191. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1103.23-1103.31"
  176192. }
  176193. },
  176194. "cpu_I._zz_10_": {
  176195. "hide_name": 0,
  176196. "bits": [ 1240, 1239 ],
  176197. "attributes": {
  176198. "hdlname": "cpu_I _zz_10_",
  176199. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:692.20-692.27"
  176200. }
  176201. },
  176202. "cpu_I._zz_110_": {
  176203. "hide_name": 0,
  176204. "bits": [ 3175, 3192, 3199, 3211, 3160, 3156, 3149, 3142, 3218, 3135, 3225, 3128, 3121, 3114, 3107, 3093, 3094, 3108, 3115, 3122, 3129, 3226, 3136, 3219, 3143, 3150, 3157, 3161, 3212, 3200, 3193, 3176 ],
  176205. "attributes": {
  176206. "hdlname": "cpu_I _zz_110_",
  176207. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1110.23-1110.31"
  176208. }
  176209. },
  176210. "cpu_I._zz_114_": {
  176211. "hide_name": 0,
  176212. "bits": [ 2052, 2053, 2054, 2055, 2056 ],
  176213. "attributes": {
  176214. "hdlname": "cpu_I _zz_114_",
  176215. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1114.23-1114.31"
  176216. }
  176217. },
  176218. "cpu_I._zz_115_": {
  176219. "hide_name": 0,
  176220. "bits": [ 2059, 2067, 2063, 2071, 2061, 2069, 2065, 2073, 2060, 2068, 2064, 2072, 2062, 2070, 2066, 2074, 2140, 2148, 2144, 2152, 2142, 2150, 2146, 2154, 2141, 2149, 2145, 2153, 2143, 2151, 2147, 2155 ],
  176221. "attributes": {
  176222. "hdlname": "cpu_I _zz_115_",
  176223. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1115.23-1115.31"
  176224. }
  176225. },
  176226. "cpu_I._zz_11_": {
  176227. "hide_name": 0,
  176228. "bits": [ 3287, 3286 ],
  176229. "attributes": {
  176230. "hdlname": "cpu_I _zz_11_",
  176231. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:694.20-694.27"
  176232. }
  176233. },
  176234. "cpu_I._zz_122_": {
  176235. "hide_name": 0,
  176236. "bits": [ 966, 964, 962 ],
  176237. "attributes": {
  176238. "hdlname": "cpu_I _zz_122_",
  176239. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1123.23-1123.31"
  176240. }
  176241. },
  176242. "cpu_I._zz_125_": {
  176243. "hide_name": 0,
  176244. "bits": [ 943 ],
  176245. "attributes": {
  176246. "hdlname": "cpu_I _zz_125_",
  176247. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1126.23-1126.31"
  176248. }
  176249. },
  176250. "cpu_I._zz_126_": {
  176251. "hide_name": 0,
  176252. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176253. "attributes": {
  176254. "hdlname": "cpu_I _zz_126_",
  176255. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1127.23-1127.31"
  176256. }
  176257. },
  176258. "cpu_I._zz_127_": {
  176259. "hide_name": 0,
  176260. "bits": [ 943 ],
  176261. "attributes": {
  176262. "hdlname": "cpu_I _zz_127_",
  176263. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1128.23-1128.31"
  176264. }
  176265. },
  176266. "cpu_I._zz_128_": {
  176267. "hide_name": 0,
  176268. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176269. "attributes": {
  176270. "hdlname": "cpu_I _zz_128_",
  176271. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1129.23-1129.31"
  176272. }
  176273. },
  176274. "cpu_I._zz_129_": {
  176275. "hide_name": 0,
  176276. "bits": [ 943 ],
  176277. "attributes": {
  176278. "hdlname": "cpu_I _zz_129_",
  176279. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1130.23-1130.31"
  176280. }
  176281. },
  176282. "cpu_I._zz_12_": {
  176283. "hide_name": 0,
  176284. "bits": [ 3287, 3286 ],
  176285. "attributes": {
  176286. "hdlname": "cpu_I _zz_12_",
  176287. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:695.20-695.27"
  176288. }
  176289. },
  176290. "cpu_I._zz_130_": {
  176291. "hide_name": 0,
  176292. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176293. "attributes": {
  176294. "hdlname": "cpu_I _zz_130_",
  176295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1131.23-1131.31"
  176296. }
  176297. },
  176298. "cpu_I._zz_132_": {
  176299. "hide_name": 0,
  176300. "bits": [ 943 ],
  176301. "attributes": {
  176302. "hdlname": "cpu_I _zz_132_",
  176303. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1136.23-1136.31"
  176304. }
  176305. },
  176306. "cpu_I._zz_133_": {
  176307. "hide_name": 0,
  176308. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176309. "attributes": {
  176310. "hdlname": "cpu_I _zz_133_",
  176311. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1137.23-1137.31"
  176312. }
  176313. },
  176314. "cpu_I._zz_134_": {
  176315. "hide_name": 0,
  176316. "bits": [ 943 ],
  176317. "attributes": {
  176318. "hdlname": "cpu_I _zz_134_",
  176319. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1138.23-1138.31"
  176320. }
  176321. },
  176322. "cpu_I._zz_135_": {
  176323. "hide_name": 0,
  176324. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176325. "attributes": {
  176326. "hdlname": "cpu_I _zz_135_",
  176327. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1139.23-1139.31"
  176328. }
  176329. },
  176330. "cpu_I._zz_136_": {
  176331. "hide_name": 0,
  176332. "bits": [ 943 ],
  176333. "attributes": {
  176334. "hdlname": "cpu_I _zz_136_",
  176335. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1140.23-1140.31"
  176336. }
  176337. },
  176338. "cpu_I._zz_137_": {
  176339. "hide_name": 0,
  176340. "bits": [ 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  176341. "attributes": {
  176342. "hdlname": "cpu_I _zz_137_",
  176343. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1141.23-1141.31"
  176344. }
  176345. },
  176346. "cpu_I._zz_138_": {
  176347. "hide_name": 0,
  176348. "bits": [ "0" ],
  176349. "attributes": {
  176350. "hdlname": "cpu_I _zz_138_",
  176351. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1162.23-1162.31"
  176352. }
  176353. },
  176354. "cpu_I._zz_13_": {
  176355. "hide_name": 0,
  176356. "bits": [ 3287, 3286 ],
  176357. "attributes": {
  176358. "hdlname": "cpu_I _zz_13_",
  176359. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:696.20-696.27"
  176360. }
  176361. },
  176362. "cpu_I._zz_140_": {
  176363. "hide_name": 0,
  176364. "bits": [ "0" ],
  176365. "attributes": {
  176366. "hdlname": "cpu_I _zz_140_",
  176367. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1164.23-1164.31"
  176368. }
  176369. },
  176370. "cpu_I._zz_141_": {
  176371. "hide_name": 0,
  176372. "bits": [ 2720, 2668, 2685, 2690, 2695, 2700, 2705, 2710, 2718, 2653, 2712, 2722, 2727, 2732, 2737, 2742, 2747, 2750, 2603, 2611, 2616, 2621, 2626, 2631, 2636, 2641, 2646, 2651, 2663, 2675, 2680, 2752 ],
  176373. "attributes": {
  176374. "hdlname": "cpu_I _zz_141_",
  176375. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1229.23-1229.31"
  176376. }
  176377. },
  176378. "cpu_I._zz_145_": {
  176379. "hide_name": 0,
  176380. "bits": [ 2842, 2770, 2759, 2848, 4120, 4115, 4110, 2846, 4099, 4047, 4098, 2852, 4089, 4084, 4079, 4074, 4069, 4064, 4059, 4054, 2851, 4038, 4033, 4028, 2845, 4019, 4014, 4009, 2849, 2756, 2771, 2843, "x" ],
  176381. "attributes": {
  176382. "hdlname": "cpu_I _zz_145_",
  176383. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1237.23-1237.31"
  176384. }
  176385. },
  176386. "cpu_I._zz_147_": {
  176387. "hide_name": 0,
  176388. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176389. "attributes": {
  176390. "hdlname": "cpu_I _zz_147_",
  176391. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1240.23-1240.31"
  176392. }
  176393. },
  176394. "cpu_I._zz_148_": {
  176395. "hide_name": 0,
  176396. "bits": [ "0", "0", "0", 7052, "0", "0", "0", 7053, "0", "0", "0", 7054, 7055, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176397. "attributes": {
  176398. "hdlname": "cpu_I _zz_148_",
  176399. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1320.23-1320.31",
  176400. "unused_bits": "3 7 11 12"
  176401. }
  176402. },
  176403. "cpu_I._zz_149_": {
  176404. "hide_name": 0,
  176405. "bits": [ "0", "0", "0", 7056, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176406. "attributes": {
  176407. "hdlname": "cpu_I _zz_149_",
  176408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1321.23-1321.31",
  176409. "unused_bits": "3"
  176410. }
  176411. },
  176412. "cpu_I._zz_14_": {
  176413. "hide_name": 0,
  176414. "bits": [ 3276, 3289 ],
  176415. "attributes": {
  176416. "hdlname": "cpu_I _zz_14_",
  176417. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:704.20-704.27"
  176418. }
  176419. },
  176420. "cpu_I._zz_150_": {
  176421. "hide_name": 0,
  176422. "bits": [ "0", "0", "0", 7057, "0", "0", "0", 7058, "0", "0", "0", 7059, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176423. "attributes": {
  176424. "hdlname": "cpu_I _zz_150_",
  176425. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1322.23-1322.31",
  176426. "unused_bits": "3 7 11"
  176427. }
  176428. },
  176429. "cpu_I._zz_152_": {
  176430. "hide_name": 0,
  176431. "bits": [ 1029, 1029, "0", 7060, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 7061 ],
  176432. "attributes": {
  176433. "hdlname": "cpu_I _zz_152_",
  176434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1324.23-1324.31",
  176435. "unused_bits": "3 31"
  176436. }
  176437. },
  176438. "cpu_I._zz_155_": {
  176439. "hide_name": 0,
  176440. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176441. "attributes": {
  176442. "hdlname": "cpu_I _zz_155_",
  176443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1327.23-1327.31"
  176444. }
  176445. },
  176446. "cpu_I._zz_156_": {
  176447. "hide_name": 0,
  176448. "bits": [ "1", 7062, 7063, 7063 ],
  176449. "attributes": {
  176450. "hdlname": "cpu_I _zz_156_",
  176451. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1340.23-1340.31",
  176452. "unused_bits": "1 2 3"
  176453. }
  176454. },
  176455. "cpu_I._zz_15_": {
  176456. "hide_name": 0,
  176457. "bits": [ 3276, 3289 ],
  176458. "attributes": {
  176459. "hdlname": "cpu_I _zz_15_",
  176460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:705.20-705.27"
  176461. }
  176462. },
  176463. "cpu_I._zz_163_": {
  176464. "hide_name": 0,
  176465. "bits": [ "0" ],
  176466. "attributes": {
  176467. "hdlname": "cpu_I _zz_163_",
  176468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:373.23-373.31"
  176469. }
  176470. },
  176471. "cpu_I._zz_164_": {
  176472. "hide_name": 0,
  176473. "bits": [ 1378 ],
  176474. "attributes": {
  176475. "hdlname": "cpu_I _zz_164_",
  176476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:374.23-374.31"
  176477. }
  176478. },
  176479. "cpu_I._zz_167_": {
  176480. "hide_name": 0,
  176481. "bits": [ "x", "x", 7022, 7023, 7024, 7025, 7026, 7027, 7028, 7029, 7030, 7031, 7032, 7033, 7034, 7035, 7036, 7037, 7038, 7039, 7040, 7041, 7042, 7043, 7044, 7045, 7046, 7047, 7048, 7049, 7050, 7051 ],
  176482. "attributes": {
  176483. "hdlname": "cpu_I _zz_167_",
  176484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:377.23-377.31",
  176485. "unused_bits": "2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31"
  176486. }
  176487. },
  176488. "cpu_I._zz_169_": {
  176489. "hide_name": 0,
  176490. "bits": [ 2301 ],
  176491. "attributes": {
  176492. "hdlname": "cpu_I _zz_169_",
  176493. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:396.23-396.31"
  176494. }
  176495. },
  176496. "cpu_I._zz_169__SB_DFFR_D_Q": {
  176497. "hide_name": 0,
  176498. "bits": [ 1551, 2054, 2302 ],
  176499. "attributes": {
  176500. "force_downto": "00000000000000000000000000000001",
  176501. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176502. }
  176503. },
  176504. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_I3": {
  176505. "hide_name": 0,
  176506. "bits": [ 1532, 2055, 2302, 2303 ],
  176507. "attributes": {
  176508. "force_downto": "00000000000000000000000000000001",
  176509. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176510. }
  176511. },
  176512. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_O": {
  176513. "hide_name": 0,
  176514. "bits": [ 2091, 2092, 2093 ],
  176515. "attributes": {
  176516. "force_downto": "00000000000000000000000000000001",
  176517. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176518. }
  176519. },
  176520. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I2_O_SB_LUT4_O_I2": {
  176521. "hide_name": 0,
  176522. "bits": [ 1534, 2053, 2304, 2305 ],
  176523. "attributes": {
  176524. "force_downto": "00000000000000000000000000000001",
  176525. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176526. }
  176527. },
  176528. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O": {
  176529. "hide_name": 0,
  176530. "bits": [ 1530, 2052, 2306, 2307 ],
  176531. "attributes": {
  176532. "force_downto": "00000000000000000000000000000001",
  176533. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176534. }
  176535. },
  176536. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  176537. "hide_name": 0,
  176538. "bits": [ 2145, 2308, 2080 ],
  176539. "attributes": {
  176540. "force_downto": "00000000000000000000000000000001",
  176541. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176542. }
  176543. },
  176544. "cpu_I._zz_169__SB_DFFR_D_Q_SB_LUT4_I3_O_SB_LUT4_O_I2": {
  176545. "hide_name": 0,
  176546. "bits": [ 1552, 2053, 2309, 2310 ],
  176547. "attributes": {
  176548. "force_downto": "00000000000000000000000000000001",
  176549. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176550. }
  176551. },
  176552. "cpu_I._zz_169__SB_DFFSS_D_Q": {
  176553. "hide_name": 0,
  176554. "bits": [ 2058 ],
  176555. "attributes": {
  176556. "defaultvalue": "1",
  176557. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  176558. }
  176559. },
  176560. "cpu_I._zz_169__SB_DFFSS_D_Q_SB_LUT4_I3_O": {
  176561. "hide_name": 0,
  176562. "bits": [ 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029, 2029 ],
  176563. "attributes": {
  176564. "defaultvalue": "0000000000000000",
  176565. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  176566. }
  176567. },
  176568. "cpu_I._zz_169__SB_DFFSS_D_S": {
  176569. "hide_name": 0,
  176570. "bits": [ 2311 ],
  176571. "attributes": {
  176572. }
  176573. },
  176574. "cpu_I._zz_169__SB_LUT4_I3_1_I2": {
  176575. "hide_name": 0,
  176576. "bits": [ 1551, 2266, 2313, 2301 ],
  176577. "attributes": {
  176578. "force_downto": "00000000000000000000000000000001",
  176579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176580. }
  176581. },
  176582. "cpu_I._zz_169__SB_LUT4_I3_1_O": {
  176583. "hide_name": 0,
  176584. "bits": [ 2315, 2316, 2317, 2314 ],
  176585. "attributes": {
  176586. "force_downto": "00000000000000000000000000000001",
  176587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176588. }
  176589. },
  176590. "cpu_I._zz_169__SB_LUT4_I3_1_O_SB_LUT4_I0_O": {
  176591. "hide_name": 0,
  176592. "bits": [ 2112, 2318, 2296 ],
  176593. "attributes": {
  176594. "force_downto": "00000000000000000000000000000001",
  176595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176596. }
  176597. },
  176598. "cpu_I._zz_169__SB_LUT4_I3_O": {
  176599. "hide_name": 0,
  176600. "bits": [ 1533, 2266, 2319, 2312 ],
  176601. "attributes": {
  176602. "force_downto": "00000000000000000000000000000001",
  176603. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176604. }
  176605. },
  176606. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2_O": {
  176607. "hide_name": 0,
  176608. "bits": [ 2321, 2322, 2320 ],
  176609. "attributes": {
  176610. "force_downto": "00000000000000000000000000000001",
  176611. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176612. }
  176613. },
  176614. "cpu_I._zz_169__SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_I1_O": {
  176615. "hide_name": 0,
  176616. "bits": [ 2323, 2324, 2294 ],
  176617. "attributes": {
  176618. "force_downto": "00000000000000000000000000000001",
  176619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176620. }
  176621. },
  176622. "cpu_I._zz_16_": {
  176623. "hide_name": 0,
  176624. "bits": [ 3276, 3289 ],
  176625. "attributes": {
  176626. "hdlname": "cpu_I _zz_16_",
  176627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:706.20-706.27"
  176628. }
  176629. },
  176630. "cpu_I._zz_170_": {
  176631. "hide_name": 0,
  176632. "bits": [ "1" ],
  176633. "attributes": {
  176634. "hdlname": "cpu_I _zz_170_",
  176635. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:397.23-397.31"
  176636. }
  176637. },
  176638. "cpu_I._zz_174_": {
  176639. "hide_name": 0,
  176640. "bits": [ 1378 ],
  176641. "attributes": {
  176642. "hdlname": "cpu_I _zz_174_",
  176643. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:401.23-401.31"
  176644. }
  176645. },
  176646. "cpu_I._zz_175_": {
  176647. "hide_name": 0,
  176648. "bits": [ "0" ],
  176649. "attributes": {
  176650. "hdlname": "cpu_I _zz_175_",
  176651. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:402.23-402.31"
  176652. }
  176653. },
  176654. "cpu_I._zz_17_": {
  176655. "hide_name": 0,
  176656. "bits": [ 3288, 1362 ],
  176657. "attributes": {
  176658. "hdlname": "cpu_I _zz_17_",
  176659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:712.20-712.27"
  176660. }
  176661. },
  176662. "cpu_I._zz_180_": {
  176663. "hide_name": 0,
  176664. "bits": [ 2301 ],
  176665. "attributes": {
  176666. "hdlname": "cpu_I _zz_180_",
  176667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:407.23-407.31"
  176668. }
  176669. },
  176670. "cpu_I._zz_181_": {
  176671. "hide_name": 0,
  176672. "bits": [ "0" ],
  176673. "attributes": {
  176674. "hdlname": "cpu_I _zz_181_",
  176675. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:408.23-408.31"
  176676. }
  176677. },
  176678. "cpu_I._zz_186_": {
  176679. "hide_name": 0,
  176680. "bits": [ 944 ],
  176681. "attributes": {
  176682. "hdlname": "cpu_I _zz_186_",
  176683. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:413.23-413.31"
  176684. }
  176685. },
  176686. "cpu_I._zz_187_": {
  176687. "hide_name": 0,
  176688. "bits": [ 966, 964 ],
  176689. "attributes": {
  176690. "hdlname": "cpu_I _zz_187_",
  176691. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:414.23-414.31"
  176692. }
  176693. },
  176694. "cpu_I._zz_18_": {
  176695. "hide_name": 0,
  176696. "bits": [ 3288, 1362 ],
  176697. "attributes": {
  176698. "hdlname": "cpu_I _zz_18_",
  176699. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:713.20-713.27"
  176700. }
  176701. },
  176702. "cpu_I._zz_191_": {
  176703. "hide_name": 0,
  176704. "bits": [ "0" ],
  176705. "attributes": {
  176706. "hdlname": "cpu_I _zz_191_",
  176707. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:418.23-418.31"
  176708. }
  176709. },
  176710. "cpu_I._zz_193_": {
  176711. "hide_name": 0,
  176712. "bits": [ "0" ],
  176713. "attributes": {
  176714. "hdlname": "cpu_I _zz_193_",
  176715. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:420.23-420.31"
  176716. }
  176717. },
  176718. "cpu_I._zz_196_": {
  176719. "hide_name": 0,
  176720. "bits": [ 964 ],
  176721. "attributes": {
  176722. "hdlname": "cpu_I _zz_196_",
  176723. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:423.23-423.31"
  176724. }
  176725. },
  176726. "cpu_I._zz_198_": {
  176727. "hide_name": 0,
  176728. "bits": [ 2327 ],
  176729. "attributes": {
  176730. "hdlname": "cpu_I _zz_198_",
  176731. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:425.23-425.31"
  176732. }
  176733. },
  176734. "cpu_I._zz_199_": {
  176735. "hide_name": 0,
  176736. "bits": [ 2327 ],
  176737. "attributes": {
  176738. "hdlname": "cpu_I _zz_199_",
  176739. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:426.23-426.31"
  176740. }
  176741. },
  176742. "cpu_I._zz_19_": {
  176743. "hide_name": 0,
  176744. "bits": [ 3288, 1362 ],
  176745. "attributes": {
  176746. "hdlname": "cpu_I _zz_19_",
  176747. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:714.20-714.27"
  176748. }
  176749. },
  176750. "cpu_I._zz_1_": {
  176751. "hide_name": 0,
  176752. "bits": [ 2331, 2330 ],
  176753. "attributes": {
  176754. "hdlname": "cpu_I _zz_1_",
  176755. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:675.20-675.26"
  176756. }
  176757. },
  176758. "cpu_I._zz_200_": {
  176759. "hide_name": 0,
  176760. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  176761. "attributes": {
  176762. "hdlname": "cpu_I _zz_200_",
  176763. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:427.23-427.31"
  176764. }
  176765. },
  176766. "cpu_I._zz_201_": {
  176767. "hide_name": 0,
  176768. "bits": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5041, 5042, 5043, 5044, 5045, 5046, 5047, 5048, 5049, 5050, 5051, 5052, 5053, 5054, 5055, 5056, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176769. "attributes": {
  176770. "hdlname": "cpu_I _zz_201_",
  176771. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:428.23-428.31"
  176772. }
  176773. },
  176774. "cpu_I._zz_202_": {
  176775. "hide_name": 0,
  176776. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176777. "attributes": {
  176778. "hdlname": "cpu_I _zz_202_",
  176779. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:429.23-429.31"
  176780. }
  176781. },
  176782. "cpu_I._zz_203_": {
  176783. "hide_name": 0,
  176784. "bits": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5041, 5042, 5043, 5044, 5045, 5046, 5047, 5048, 5049, 5050, 5051, 5052, 5053, 5054, 5055, 5056, "0" ],
  176785. "attributes": {
  176786. "hdlname": "cpu_I _zz_203_",
  176787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:430.23-430.31"
  176788. }
  176789. },
  176790. "cpu_I._zz_204_": {
  176791. "hide_name": 0,
  176792. "bits": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5041, 5042, 5043, 5044, 5045, 5046, 5047, 5048, 5049, 5050, 5051, 5052, 5053, 5054, 5055, 5056, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  176793. "attributes": {
  176794. "hdlname": "cpu_I _zz_204_",
  176795. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:431.23-431.31"
  176796. }
  176797. },
  176798. "cpu_I._zz_205_": {
  176799. "hide_name": 0,
  176800. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 5006, 5007, 5008, 5009, 5010, 5011, 5012, 5013, 5014, 5015, 5016, 5017, 5018, 5019, 5020, 5021, 4995, 4994, 4993, 4992, 4991, 4990, 4989, 5003, 5002, 5001, 5000, 4999, 4998, 4997, 4996, 4988, 4987, 4987 ],
  176801. "attributes": {
  176802. "hdlname": "cpu_I _zz_205_",
  176803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:432.23-432.31"
  176804. }
  176805. },
  176806. "cpu_I._zz_206_": {
  176807. "hide_name": 0,
  176808. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 5006, 5007, 5008, 5009, 5010, 5011, 5012, 5013, 5014, 5015, 5016, 5017, 5018, 5019, 5020, 5021, 4995, 4994, 4993, 4992, 4991, 4990, 4989, 5003, 5002, 5001, 5000, 4999, 4998, 4997, 4996, 4988, 4987, 4987, 4987, 4987 ],
  176809. "attributes": {
  176810. "hdlname": "cpu_I _zz_206_",
  176811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:433.23-433.31"
  176812. }
  176813. },
  176814. "cpu_I._zz_207_": {
  176815. "hide_name": 0,
  176816. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 4970, 4971, 4972, 4973, 4974, 4975, 4976, 4977, 4978, 4979, 4980, 4981, 4982, 4983, 4984, 4985, 4959, 4958, 4957, 4956, 4955, 4954, 4953, 4952, 4967, 4966, 4965, 4964, 4963, 4962, 4961, 4960, 4951, 4950 ],
  176817. "attributes": {
  176818. "hdlname": "cpu_I _zz_207_",
  176819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:434.23-434.31"
  176820. }
  176821. },
  176822. "cpu_I._zz_208_": {
  176823. "hide_name": 0,
  176824. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 4970, 4971, 4972, 4973, 4974, 4975, 4976, 4977, 4978, 4979, 4980, 4981, 4982, 4983, 4984, 4985, 4959, 4958, 4957, 4956, 4955, 4954, 4953, 4952, 4967, 4966, 4965, 4964, 4963, 4962, 4961, 4960, 4951, 4950, 4950, 4950 ],
  176825. "attributes": {
  176826. "hdlname": "cpu_I _zz_208_",
  176827. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:435.23-435.31"
  176828. }
  176829. },
  176830. "cpu_I._zz_209_": {
  176831. "hide_name": 0,
  176832. "bits": [ 2333 ],
  176833. "attributes": {
  176834. "hdlname": "cpu_I _zz_209_",
  176835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:436.23-436.31"
  176836. }
  176837. },
  176838. "cpu_I._zz_209__SB_LUT4_O_I3": {
  176839. "hide_name": 0,
  176840. "bits": [ 2328, 2332 ],
  176841. "attributes": {
  176842. "force_downto": "00000000000000000000000000000001",
  176843. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176844. }
  176845. },
  176846. "cpu_I._zz_20_": {
  176847. "hide_name": 0,
  176848. "bits": [ 4278, 4277 ],
  176849. "attributes": {
  176850. "hdlname": "cpu_I _zz_20_",
  176851. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:715.20-715.27"
  176852. }
  176853. },
  176854. "cpu_I._zz_210_": {
  176855. "hide_name": 0,
  176856. "bits": [ 2337 ],
  176857. "attributes": {
  176858. "hdlname": "cpu_I _zz_210_",
  176859. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:437.23-437.31"
  176860. }
  176861. },
  176862. "cpu_I._zz_210__SB_LUT4_O_I3": {
  176863. "hide_name": 0,
  176864. "bits": [ 2336, 2331, 3278 ],
  176865. "attributes": {
  176866. "force_downto": "00000000000000000000000000000001",
  176867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176868. }
  176869. },
  176870. "cpu_I._zz_211_": {
  176871. "hide_name": 0,
  176872. "bits": [ 2339 ],
  176873. "attributes": {
  176874. "hdlname": "cpu_I _zz_211_",
  176875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:438.23-438.31"
  176876. }
  176877. },
  176878. "cpu_I._zz_212_": {
  176879. "hide_name": 0,
  176880. "bits": [ 2340 ],
  176881. "attributes": {
  176882. "hdlname": "cpu_I _zz_212_",
  176883. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:439.23-439.31"
  176884. }
  176885. },
  176886. "cpu_I._zz_213_": {
  176887. "hide_name": 0,
  176888. "bits": [ 2341 ],
  176889. "attributes": {
  176890. "hdlname": "cpu_I _zz_213_",
  176891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:440.23-440.31"
  176892. }
  176893. },
  176894. "cpu_I._zz_213__SB_LUT4_O_I3": {
  176895. "hide_name": 0,
  176896. "bits": [ 1543, 1364, 2338 ],
  176897. "attributes": {
  176898. "force_downto": "00000000000000000000000000000001",
  176899. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176900. }
  176901. },
  176902. "cpu_I._zz_213__SB_LUT4_O_I3_SB_LUT4_I3_O": {
  176903. "hide_name": 0,
  176904. "bits": [ 3276, 2343, 2342 ],
  176905. "attributes": {
  176906. "force_downto": "00000000000000000000000000000001",
  176907. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176908. }
  176909. },
  176910. "cpu_I._zz_214_": {
  176911. "hide_name": 0,
  176912. "bits": [ 2348, 2444, 2352, 2430, 2476, 2514, 2548, 2556, 2559, 2568, 2571, 2355, 2483, 2358, 2478, 2402, 2448, 2447, 2446, 2445, 2440, 2438, 2436, 2434, 2432, 2427, 2425, 2418, 2417, 2414, 2413, 2409, "x" ],
  176913. "attributes": {
  176914. "hdlname": "cpu_I _zz_214_",
  176915. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:441.23-441.31"
  176916. }
  176917. },
  176918. "cpu_I._zz_215_": {
  176919. "hide_name": 0,
  176920. "bits": [ 2348, 2444, 2352, 2430, 2476, 2514, 2548, 2556, 2559, 2568, 2571, 2355, 2483, 2358, 2478, 2402, 2448, 2447, 2446, 2445, 2440, 2438, 2436, 2434, 2432, 2427, 2425, 2418, 2417, 2414, 2413, 2409 ],
  176921. "attributes": {
  176922. "hdlname": "cpu_I _zz_215_",
  176923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:442.23-442.31"
  176924. }
  176925. },
  176926. "cpu_I._zz_215__SB_LUT4_O_11_I3": {
  176927. "hide_name": 0,
  176928. "bits": [ 2344, 2356, 2357 ],
  176929. "attributes": {
  176930. "force_downto": "00000000000000000000000000000001",
  176931. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176932. }
  176933. },
  176934. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2": {
  176935. "hide_name": 0,
  176936. "bits": [ 2359, 2360 ],
  176937. "attributes": {
  176938. "force_downto": "00000000000000000000000000000001",
  176939. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176940. }
  176941. },
  176942. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  176943. "hide_name": 0,
  176944. "bits": [ 2362, 2364, 2365 ],
  176945. "attributes": {
  176946. "force_downto": "00000000000000000000000000000001",
  176947. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176948. }
  176949. },
  176950. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  176951. "hide_name": 0,
  176952. "bits": [ 2367, 2375, 2368 ],
  176953. "attributes": {
  176954. "force_downto": "00000000000000000000000000000001",
  176955. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176956. }
  176957. },
  176958. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  176959. "hide_name": 0,
  176960. "bits": [ 2372, 2381, 2373 ],
  176961. "attributes": {
  176962. "force_downto": "00000000000000000000000000000001",
  176963. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176964. }
  176965. },
  176966. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  176967. "hide_name": 0,
  176968. "bits": [ 2372, 2374, 2376 ],
  176969. "attributes": {
  176970. "force_downto": "00000000000000000000000000000001",
  176971. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176972. }
  176973. },
  176974. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  176975. "hide_name": 0,
  176976. "bits": [ 2367, 2371, 2369 ],
  176977. "attributes": {
  176978. "force_downto": "00000000000000000000000000000001",
  176979. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176980. }
  176981. },
  176982. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  176983. "hide_name": 0,
  176984. "bits": [ 2372, 2377, 2388 ],
  176985. "attributes": {
  176986. "force_downto": "00000000000000000000000000000001",
  176987. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176988. }
  176989. },
  176990. "cpu_I._zz_215__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  176991. "hide_name": 0,
  176992. "bits": [ 2372, 2389, 2391 ],
  176993. "attributes": {
  176994. "force_downto": "00000000000000000000000000000001",
  176995. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  176996. }
  176997. },
  176998. "cpu_I._zz_215__SB_LUT4_O_12_I3": {
  176999. "hide_name": 0,
  177000. "bits": [ 2344, 2400, 2401 ],
  177001. "attributes": {
  177002. "force_downto": "00000000000000000000000000000001",
  177003. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177004. }
  177005. },
  177006. "cpu_I._zz_215__SB_LUT4_O_12_I3_SB_LUT4_O_I2": {
  177007. "hide_name": 0,
  177008. "bits": [ 2359, 2403, 2404 ],
  177009. "attributes": {
  177010. "force_downto": "00000000000000000000000000000001",
  177011. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177012. }
  177013. },
  177014. "cpu_I._zz_215__SB_LUT4_O_12_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177015. "hide_name": 0,
  177016. "bits": [ 2362, 2406, 2407 ],
  177017. "attributes": {
  177018. "force_downto": "00000000000000000000000000000001",
  177019. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177020. }
  177021. },
  177022. "cpu_I._zz_215__SB_LUT4_O_13_I3": {
  177023. "hide_name": 0,
  177024. "bits": [ 2408, 2400 ],
  177025. "attributes": {
  177026. "force_downto": "00000000000000000000000000000001",
  177027. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177028. }
  177029. },
  177030. "cpu_I._zz_215__SB_LUT4_O_15_I3": {
  177031. "hide_name": 0,
  177032. "bits": [ 2344, 2408, 2356 ],
  177033. "attributes": {
  177034. "force_downto": "00000000000000000000000000000001",
  177035. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177036. }
  177037. },
  177038. "cpu_I._zz_215__SB_LUT4_O_17_I3": {
  177039. "hide_name": 0,
  177040. "bits": [ 2344, 2353, 2354 ],
  177041. "attributes": {
  177042. "force_downto": "00000000000000000000000000000001",
  177043. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177044. }
  177045. },
  177046. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O_1_I3": {
  177047. "hide_name": 0,
  177048. "bits": [ 2359, 2410, 2421 ],
  177049. "attributes": {
  177050. "force_downto": "00000000000000000000000000000001",
  177051. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177052. }
  177053. },
  177054. "cpu_I._zz_215__SB_LUT4_O_17_I3_SB_LUT4_O_1_I3_SB_LUT4_I2_O": {
  177055. "hide_name": 0,
  177056. "bits": [ 2344, 2408, 2422 ],
  177057. "attributes": {
  177058. "force_downto": "00000000000000000000000000000001",
  177059. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177060. }
  177061. },
  177062. "cpu_I._zz_215__SB_LUT4_O_2_I1": {
  177063. "hide_name": 0,
  177064. "bits": [ 2344, 2428, 2429, 2422 ],
  177065. "attributes": {
  177066. "force_downto": "00000000000000000000000000000001",
  177067. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177068. }
  177069. },
  177070. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_1_I3": {
  177071. "hide_name": 0,
  177072. "bits": [ 2359, 2419, 2420 ],
  177073. "attributes": {
  177074. "force_downto": "00000000000000000000000000000001",
  177075. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177076. }
  177077. },
  177078. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2": {
  177079. "hide_name": 0,
  177080. "bits": [ 2359, 2362, 2449, 2450 ],
  177081. "attributes": {
  177082. "force_downto": "00000000000000000000000000000001",
  177083. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177084. }
  177085. },
  177086. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3": {
  177087. "hide_name": 0,
  177088. "bits": [ 2367, 2520, 2455 ],
  177089. "attributes": {
  177090. "force_downto": "00000000000000000000000000000001",
  177091. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177092. }
  177093. },
  177094. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2": {
  177095. "hide_name": 0,
  177096. "bits": [ 2372, 2458, 2456 ],
  177097. "attributes": {
  177098. "force_downto": "00000000000000000000000000000001",
  177099. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177100. }
  177101. },
  177102. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  177103. "hide_name": 0,
  177104. "bits": [ 2372, 2457, 2460 ],
  177105. "attributes": {
  177106. "force_downto": "00000000000000000000000000000001",
  177107. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177108. }
  177109. },
  177110. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  177111. "hide_name": 0,
  177112. "bits": [ 2367, 2464, 2452 ],
  177113. "attributes": {
  177114. "force_downto": "00000000000000000000000000000001",
  177115. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177116. }
  177117. },
  177118. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  177119. "hide_name": 0,
  177120. "bits": [ 2372, 2468, 2462 ],
  177121. "attributes": {
  177122. "force_downto": "00000000000000000000000000000001",
  177123. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177124. }
  177125. },
  177126. "cpu_I._zz_215__SB_LUT4_O_2_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177127. "hide_name": 0,
  177128. "bits": [ 2372, 2465, 2463 ],
  177129. "attributes": {
  177130. "force_downto": "00000000000000000000000000000001",
  177131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177132. }
  177133. },
  177134. "cpu_I._zz_215__SB_LUT4_O_30_I2": {
  177135. "hide_name": 0,
  177136. "bits": [ 2344, 2412, 2477 ],
  177137. "attributes": {
  177138. "force_downto": "00000000000000000000000000000001",
  177139. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177140. }
  177141. },
  177142. "cpu_I._zz_215__SB_LUT4_O_31_I2": {
  177143. "hide_name": 0,
  177144. "bits": [ 2344, 2416, 2482 ],
  177145. "attributes": {
  177146. "force_downto": "00000000000000000000000000000001",
  177147. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177148. }
  177149. },
  177150. "cpu_I._zz_215__SB_LUT4_O_3_I2": {
  177151. "hide_name": 0,
  177152. "bits": [ 2344, 2475, 2439 ],
  177153. "attributes": {
  177154. "force_downto": "00000000000000000000000000000001",
  177155. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177156. }
  177157. },
  177158. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2": {
  177159. "hide_name": 0,
  177160. "bits": [ 2359, 2485, 2487 ],
  177161. "attributes": {
  177162. "force_downto": "00000000000000000000000000000001",
  177163. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177164. }
  177165. },
  177166. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3": {
  177167. "hide_name": 0,
  177168. "bits": [ 2362, 2491, 2494 ],
  177169. "attributes": {
  177170. "force_downto": "00000000000000000000000000000001",
  177171. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177172. }
  177173. },
  177174. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_1_I2": {
  177175. "hide_name": 0,
  177176. "bits": [ 2367, 2495, 2496 ],
  177177. "attributes": {
  177178. "force_downto": "00000000000000000000000000000001",
  177179. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177180. }
  177181. },
  177182. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2": {
  177183. "hide_name": 0,
  177184. "bits": [ 2367, 2492, 2493 ],
  177185. "attributes": {
  177186. "force_downto": "00000000000000000000000000000001",
  177187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177188. }
  177189. },
  177190. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177191. "hide_name": 0,
  177192. "bits": [ 2362, 2490, 2489 ],
  177193. "attributes": {
  177194. "force_downto": "00000000000000000000000000000001",
  177195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177196. }
  177197. },
  177198. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1_I2": {
  177199. "hide_name": 0,
  177200. "bits": [ 2367, 2459, 2461 ],
  177201. "attributes": {
  177202. "force_downto": "00000000000000000000000000000001",
  177203. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177204. }
  177205. },
  177206. "cpu_I._zz_215__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  177207. "hide_name": 0,
  177208. "bits": [ 2367, 2500, 2501 ],
  177209. "attributes": {
  177210. "force_downto": "00000000000000000000000000000001",
  177211. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177212. }
  177213. },
  177214. "cpu_I._zz_215__SB_LUT4_O_3_I3": {
  177215. "hide_name": 0,
  177216. "bits": [ 2344, 2408, 2439 ],
  177217. "attributes": {
  177218. "force_downto": "00000000000000000000000000000001",
  177219. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177220. }
  177221. },
  177222. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O_I2": {
  177223. "hide_name": 0,
  177224. "bits": [ 2359, 2484, 2486 ],
  177225. "attributes": {
  177226. "force_downto": "00000000000000000000000000000001",
  177227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177228. }
  177229. },
  177230. "cpu_I._zz_215__SB_LUT4_O_3_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177231. "hide_name": 0,
  177232. "bits": [ 2362, 2506, 2507 ],
  177233. "attributes": {
  177234. "force_downto": "00000000000000000000000000000001",
  177235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177236. }
  177237. },
  177238. "cpu_I._zz_215__SB_LUT4_O_4_I1": {
  177239. "hide_name": 0,
  177240. "bits": [ 2344, 2512, 2513, 2437 ],
  177241. "attributes": {
  177242. "force_downto": "00000000000000000000000000000001",
  177243. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177244. }
  177245. },
  177246. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2": {
  177247. "hide_name": 0,
  177248. "bits": [ 2362, 2363, 2515 ],
  177249. "attributes": {
  177250. "force_downto": "00000000000000000000000000000001",
  177251. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177252. }
  177253. },
  177254. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  177255. "hide_name": 0,
  177256. "bits": [ 2367, 2370, 2518 ],
  177257. "attributes": {
  177258. "force_downto": "00000000000000000000000000000001",
  177259. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177260. }
  177261. },
  177262. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  177263. "hide_name": 0,
  177264. "bits": [ 2372, 2390, 2497 ],
  177265. "attributes": {
  177266. "force_downto": "00000000000000000000000000000001",
  177267. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177268. }
  177269. },
  177270. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177271. "hide_name": 0,
  177272. "bits": [ 2372, 2498, 2499 ],
  177273. "attributes": {
  177274. "force_downto": "00000000000000000000000000000001",
  177275. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177276. }
  177277. },
  177278. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177279. "hide_name": 0,
  177280. "bits": [ 2367, 2519, 2520 ],
  177281. "attributes": {
  177282. "force_downto": "00000000000000000000000000000001",
  177283. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177284. }
  177285. },
  177286. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  177287. "hide_name": 0,
  177288. "bits": [ 2372, 2502, 2503 ],
  177289. "attributes": {
  177290. "force_downto": "00000000000000000000000000000001",
  177291. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177292. }
  177293. },
  177294. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  177295. "hide_name": 0,
  177296. "bits": [ 2372, 2504, 2505 ],
  177297. "attributes": {
  177298. "force_downto": "00000000000000000000000000000001",
  177299. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177300. }
  177301. },
  177302. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3": {
  177303. "hide_name": 0,
  177304. "bits": [ 2359, 2362, 2529, 2516 ],
  177305. "attributes": {
  177306. "force_downto": "00000000000000000000000000000001",
  177307. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177308. }
  177309. },
  177310. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  177311. "hide_name": 0,
  177312. "bits": [ 2367, 2454, 2453 ],
  177313. "attributes": {
  177314. "force_downto": "00000000000000000000000000000001",
  177315. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177316. }
  177317. },
  177318. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  177319. "hide_name": 0,
  177320. "bits": [ 2372, 2530, 2531 ],
  177321. "attributes": {
  177322. "force_downto": "00000000000000000000000000000001",
  177323. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177324. }
  177325. },
  177326. "cpu_I._zz_215__SB_LUT4_O_4_I1_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2_SB_LUT4_I2_O": {
  177327. "hide_name": 0,
  177328. "bits": [ 2367, 2534, 2533 ],
  177329. "attributes": {
  177330. "force_downto": "00000000000000000000000000000001",
  177331. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177332. }
  177333. },
  177334. "cpu_I._zz_215__SB_LUT4_O_4_I3": {
  177335. "hide_name": 0,
  177336. "bits": [ 2344, 2408, 2437 ],
  177337. "attributes": {
  177338. "force_downto": "00000000000000000000000000000001",
  177339. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177340. }
  177341. },
  177342. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2": {
  177343. "hide_name": 0,
  177344. "bits": [ 2359, 2415, 2361 ],
  177345. "attributes": {
  177346. "force_downto": "00000000000000000000000000000001",
  177347. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177348. }
  177349. },
  177350. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177351. "hide_name": 0,
  177352. "bits": [ 2362, 2538, 2539 ],
  177353. "attributes": {
  177354. "force_downto": "00000000000000000000000000000001",
  177355. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177356. }
  177357. },
  177358. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  177359. "hide_name": 0,
  177360. "bits": [ 2367, 2410, 2540 ],
  177361. "attributes": {
  177362. "force_downto": "00000000000000000000000000000001",
  177363. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177364. }
  177365. },
  177366. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_I3_O": {
  177367. "hide_name": 0,
  177368. "bits": [ 2362, 2411, 2423 ],
  177369. "attributes": {
  177370. "force_downto": "00000000000000000000000000000001",
  177371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177372. }
  177373. },
  177374. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  177375. "hide_name": 0,
  177376. "bits": [ 2367, 2541, 2542 ],
  177377. "attributes": {
  177378. "force_downto": "00000000000000000000000000000001",
  177379. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177380. }
  177381. },
  177382. "cpu_I._zz_215__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  177383. "hide_name": 0,
  177384. "bits": [ 2372, 2543, 2544 ],
  177385. "attributes": {
  177386. "force_downto": "00000000000000000000000000000001",
  177387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177388. }
  177389. },
  177390. "cpu_I._zz_215__SB_LUT4_O_5_I2": {
  177391. "hide_name": 0,
  177392. "bits": [ 2344, 2547, 2435 ],
  177393. "attributes": {
  177394. "force_downto": "00000000000000000000000000000001",
  177395. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177396. }
  177397. },
  177398. "cpu_I._zz_215__SB_LUT4_O_5_I2_SB_LUT4_O_I2": {
  177399. "hide_name": 0,
  177400. "bits": [ 2359, 2480, 2549 ],
  177401. "attributes": {
  177402. "force_downto": "00000000000000000000000000000001",
  177403. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177404. }
  177405. },
  177406. "cpu_I._zz_215__SB_LUT4_O_6_I1": {
  177407. "hide_name": 0,
  177408. "bits": [ 2344, 2554, 2555, 2433 ],
  177409. "attributes": {
  177410. "force_downto": "00000000000000000000000000000001",
  177411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177412. }
  177413. },
  177414. "cpu_I._zz_215__SB_LUT4_O_6_I1_SB_LUT4_O_I2": {
  177415. "hide_name": 0,
  177416. "bits": [ 2362, 2405, 2451 ],
  177417. "attributes": {
  177418. "force_downto": "00000000000000000000000000000001",
  177419. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177420. }
  177421. },
  177422. "cpu_I._zz_215__SB_LUT4_O_6_I3": {
  177423. "hide_name": 0,
  177424. "bits": [ 2344, 2408, 2433 ],
  177425. "attributes": {
  177426. "force_downto": "00000000000000000000000000000001",
  177427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177428. }
  177429. },
  177430. "cpu_I._zz_215__SB_LUT4_O_6_I3_SB_LUT4_O_I1": {
  177431. "hide_name": 0,
  177432. "bits": [ 2359, 2557, 2411, 2404 ],
  177433. "attributes": {
  177434. "force_downto": "00000000000000000000000000000001",
  177435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177436. }
  177437. },
  177438. "cpu_I._zz_215__SB_LUT4_O_7_I2": {
  177439. "hide_name": 0,
  177440. "bits": [ 2344, 2431, 2558 ],
  177441. "attributes": {
  177442. "force_downto": "00000000000000000000000000000001",
  177443. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177444. }
  177445. },
  177446. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2": {
  177447. "hide_name": 0,
  177448. "bits": [ 2359, 2560 ],
  177449. "attributes": {
  177450. "force_downto": "00000000000000000000000000000001",
  177451. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177452. }
  177453. },
  177454. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_I3_O": {
  177455. "hide_name": 0,
  177456. "bits": [ 2344, 2345, 2346, 2347 ],
  177457. "attributes": {
  177458. "force_downto": "00000000000000000000000000000001",
  177459. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177460. }
  177461. },
  177462. "cpu_I._zz_215__SB_LUT4_O_7_I2_SB_LUT4_O_I3": {
  177463. "hide_name": 0,
  177464. "bits": [ 2359, 2562, 2561 ],
  177465. "attributes": {
  177466. "force_downto": "00000000000000000000000000000001",
  177467. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177468. }
  177469. },
  177470. "cpu_I._zz_215__SB_LUT4_O_8_I2": {
  177471. "hide_name": 0,
  177472. "bits": [ 2344, 2426, 2567 ],
  177473. "attributes": {
  177474. "force_downto": "00000000000000000000000000000001",
  177475. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177476. }
  177477. },
  177478. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3": {
  177479. "hide_name": 0,
  177480. "bits": [ 2359, 2410, 2569 ],
  177481. "attributes": {
  177482. "force_downto": "00000000000000000000000000000001",
  177483. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177484. }
  177485. },
  177486. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O": {
  177487. "hide_name": 0,
  177488. "bits": [ 2344, 2441, 2442, 2443 ],
  177489. "attributes": {
  177490. "force_downto": "00000000000000000000000000000001",
  177491. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177492. }
  177493. },
  177494. "cpu_I._zz_215__SB_LUT4_O_8_I2_SB_LUT4_O_I2": {
  177495. "hide_name": 0,
  177496. "bits": [ 2359, 2517, 2366 ],
  177497. "attributes": {
  177498. "force_downto": "00000000000000000000000000000001",
  177499. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177500. }
  177501. },
  177502. "cpu_I._zz_215__SB_LUT4_O_9_I2": {
  177503. "hide_name": 0,
  177504. "bits": [ 2344, 2424, 2570 ],
  177505. "attributes": {
  177506. "force_downto": "00000000000000000000000000000001",
  177507. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177508. }
  177509. },
  177510. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3": {
  177511. "hide_name": 0,
  177512. "bits": [ 2359, 2410, 2574 ],
  177513. "attributes": {
  177514. "force_downto": "00000000000000000000000000000001",
  177515. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177516. }
  177517. },
  177518. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O": {
  177519. "hide_name": 0,
  177520. "bits": [ 2344, 2349, 2350, 2351 ],
  177521. "attributes": {
  177522. "force_downto": "00000000000000000000000000000001",
  177523. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177524. }
  177525. },
  177526. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2": {
  177527. "hide_name": 0,
  177528. "bits": [ 2359, 2362, 2575, 2551 ],
  177529. "attributes": {
  177530. "force_downto": "00000000000000000000000000000001",
  177531. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177532. }
  177533. },
  177534. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2": {
  177535. "hide_name": 0,
  177536. "bits": [ 2367, 2577, 2576 ],
  177537. "attributes": {
  177538. "force_downto": "00000000000000000000000000000001",
  177539. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177540. }
  177541. },
  177542. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_I2_O": {
  177543. "hide_name": 0,
  177544. "bits": [ 2359, 2362, 2563, 2488 ],
  177545. "attributes": {
  177546. "force_downto": "00000000000000000000000000000001",
  177547. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177548. }
  177549. },
  177550. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I3": {
  177551. "hide_name": 0,
  177552. "bits": [ 2362, 2550, 2551 ],
  177553. "attributes": {
  177554. "force_downto": "00000000000000000000000000000001",
  177555. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177556. }
  177557. },
  177558. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2": {
  177559. "hide_name": 0,
  177560. "bits": [ 2362, 2410, 2584 ],
  177561. "attributes": {
  177562. "force_downto": "00000000000000000000000000000001",
  177563. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177564. }
  177565. },
  177566. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_I3_O": {
  177567. "hide_name": 0,
  177568. "bits": [ 2359, 2479, 2481 ],
  177569. "attributes": {
  177570. "force_downto": "00000000000000000000000000000001",
  177571. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177572. }
  177573. },
  177574. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  177575. "hide_name": 0,
  177576. "bits": [ 2367, 2508, 2509 ],
  177577. "attributes": {
  177578. "force_downto": "00000000000000000000000000000001",
  177579. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177580. }
  177581. },
  177582. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_1_I2": {
  177583. "hide_name": 0,
  177584. "bits": [ 2372, 2545, 2546 ],
  177585. "attributes": {
  177586. "force_downto": "00000000000000000000000000000001",
  177587. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177588. }
  177589. },
  177590. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  177591. "hide_name": 0,
  177592. "bits": [ 2362, 2585, 2586 ],
  177593. "attributes": {
  177594. "force_downto": "00000000000000000000000000000001",
  177595. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177596. }
  177597. },
  177598. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  177599. "hide_name": 0,
  177600. "bits": [ 2367, 2510, 2511 ],
  177601. "attributes": {
  177602. "force_downto": "00000000000000000000000000000001",
  177603. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177604. }
  177605. },
  177606. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_I2": {
  177607. "hide_name": 0,
  177608. "bits": [ 2359, 2572, 2573 ],
  177609. "attributes": {
  177610. "force_downto": "00000000000000000000000000000001",
  177611. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177612. }
  177613. },
  177614. "cpu_I._zz_215__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  177615. "hide_name": 0,
  177616. "bits": [ 2362, 2552, 2553 ],
  177617. "attributes": {
  177618. "force_downto": "00000000000000000000000000000001",
  177619. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177620. }
  177621. },
  177622. "cpu_I._zz_217_": {
  177623. "hide_name": 0,
  177624. "bits": [ 2588 ],
  177625. "attributes": {
  177626. "hdlname": "cpu_I _zz_217_",
  177627. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:444.23-444.31"
  177628. }
  177629. },
  177630. "cpu_I._zz_217__SB_LUT4_O_I3": {
  177631. "hide_name": 0,
  177632. "bits": [ 1543, 2328, 2587 ],
  177633. "attributes": {
  177634. "force_downto": "00000000000000000000000000000001",
  177635. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177636. }
  177637. },
  177638. "cpu_I._zz_218_": {
  177639. "hide_name": 0,
  177640. "bits": [ 2329 ],
  177641. "attributes": {
  177642. "hdlname": "cpu_I _zz_218_",
  177643. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:445.23-445.31"
  177644. }
  177645. },
  177646. "cpu_I._zz_21_": {
  177647. "hide_name": 0,
  177648. "bits": [ 4278, 4277 ],
  177649. "attributes": {
  177650. "hdlname": "cpu_I _zz_21_",
  177651. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:716.20-716.27"
  177652. }
  177653. },
  177654. "cpu_I._zz_221_": {
  177655. "hide_name": 0,
  177656. "bits": [ 3966 ],
  177657. "attributes": {
  177658. "hdlname": "cpu_I _zz_221_",
  177659. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:448.23-448.31"
  177660. }
  177661. },
  177662. "cpu_I._zz_223_": {
  177663. "hide_name": 0,
  177664. "bits": [ 2590 ],
  177665. "attributes": {
  177666. "hdlname": "cpu_I _zz_223_",
  177667. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:450.23-450.31"
  177668. }
  177669. },
  177670. "cpu_I._zz_223__SB_LUT4_O_I3": {
  177671. "hide_name": 0,
  177672. "bits": [ 1363, 1364, 2331, 2589 ],
  177673. "attributes": {
  177674. "force_downto": "00000000000000000000000000000001",
  177675. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  177676. }
  177677. },
  177678. "cpu_I._zz_224_": {
  177679. "hide_name": 0,
  177680. "bits": [ 2591 ],
  177681. "attributes": {
  177682. "hdlname": "cpu_I _zz_224_",
  177683. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:451.23-451.31"
  177684. }
  177685. },
  177686. "cpu_I._zz_226_": {
  177687. "hide_name": 0,
  177688. "bits": [ "x", "x", 7064, 7065 ],
  177689. "attributes": {
  177690. "hdlname": "cpu_I _zz_226_",
  177691. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:453.23-453.31",
  177692. "unused_bits": "2 3"
  177693. }
  177694. },
  177695. "cpu_I._zz_227_": {
  177696. "hide_name": 0,
  177697. "bits": [ "0", "0", 7066 ],
  177698. "attributes": {
  177699. "hdlname": "cpu_I _zz_227_",
  177700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:454.23-454.31",
  177701. "unused_bits": "2"
  177702. }
  177703. },
  177704. "cpu_I._zz_228_": {
  177705. "hide_name": 0,
  177706. "bits": [ "0", "0", 7067, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  177707. "attributes": {
  177708. "hdlname": "cpu_I _zz_228_",
  177709. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:455.23-455.31",
  177710. "unused_bits": "2"
  177711. }
  177712. },
  177713. "cpu_I._zz_229_": {
  177714. "hide_name": 0,
  177715. "bits": [ 1542, 1541, 1539, 1538, 1548, 1547, 1546, 1540, 1529, 1528, 2853, 1821 ],
  177716. "attributes": {
  177717. "hdlname": "cpu_I _zz_229_",
  177718. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:456.23-456.31"
  177719. }
  177720. },
  177721. "cpu_I._zz_22_": {
  177722. "hide_name": 0,
  177723. "bits": [ 3294, 3291 ],
  177724. "attributes": {
  177725. "hdlname": "cpu_I _zz_22_",
  177726. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:718.20-718.27"
  177727. }
  177728. },
  177729. "cpu_I._zz_230_": {
  177730. "hide_name": 0,
  177731. "bits": [ "0", 1542, 1541, 1539, 1538, 1548, 1547, 1546, 1540, 1529, 1528, 2853, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  177732. "attributes": {
  177733. "hdlname": "cpu_I _zz_230_",
  177734. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:457.23-457.31"
  177735. }
  177736. },
  177737. "cpu_I._zz_231_": {
  177738. "hide_name": 0,
  177739. "bits": [ 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1530, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1821 ],
  177740. "attributes": {
  177741. "hdlname": "cpu_I _zz_231_",
  177742. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:458.23-458.31"
  177743. }
  177744. },
  177745. "cpu_I._zz_232_": {
  177746. "hide_name": 0,
  177747. "bits": [ 1542, 1541, 1539, 1538, 1548, 1547, 1546, 1540, 1529, 1528, 2853, 1821 ],
  177748. "attributes": {
  177749. "hdlname": "cpu_I _zz_232_",
  177750. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:459.23-459.31"
  177751. }
  177752. },
  177753. "cpu_I._zz_233_": {
  177754. "hide_name": 0,
  177755. "bits": [ "0", 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1530, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  177756. "attributes": {
  177757. "hdlname": "cpu_I _zz_233_",
  177758. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:460.23-460.31"
  177759. }
  177760. },
  177761. "cpu_I._zz_234_": {
  177762. "hide_name": 0,
  177763. "bits": [ "0", 1542, 1541, 1539, 1538, 1548, 1547, 1546, 1540, 1529, 1528, 2853, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  177764. "attributes": {
  177765. "hdlname": "cpu_I _zz_234_",
  177766. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:461.23-461.31"
  177767. }
  177768. },
  177769. "cpu_I._zz_235_": {
  177770. "hide_name": 0,
  177771. "bits": [ 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1530, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1821 ],
  177772. "attributes": {
  177773. "hdlname": "cpu_I _zz_235_",
  177774. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:462.23-462.31"
  177775. }
  177776. },
  177777. "cpu_I._zz_236_": {
  177778. "hide_name": 0,
  177779. "bits": [ 1542, 1541, 1539, 1538, 1548, 1547, 1546, 1540, 1529, 1528, 2853, 1821 ],
  177780. "attributes": {
  177781. "hdlname": "cpu_I _zz_236_",
  177782. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:463.23-463.31"
  177783. }
  177784. },
  177785. "cpu_I._zz_238_": {
  177786. "hide_name": 0,
  177787. "bits": [ "0", "0", "1" ],
  177788. "attributes": {
  177789. "hdlname": "cpu_I _zz_238_",
  177790. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:465.23-465.31"
  177791. }
  177792. },
  177793. "cpu_I._zz_239_": {
  177794. "hide_name": 0,
  177795. "bits": [ 960, 958, 956, 954, 952 ],
  177796. "attributes": {
  177797. "hdlname": "cpu_I _zz_239_",
  177798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:466.23-466.31"
  177799. }
  177800. },
  177801. "cpu_I._zz_23_": {
  177802. "hide_name": 0,
  177803. "bits": [ 3294, 3291 ],
  177804. "attributes": {
  177805. "hdlname": "cpu_I _zz_23_",
  177806. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:719.20-719.27"
  177807. }
  177808. },
  177809. "cpu_I._zz_240_": {
  177810. "hide_name": 0,
  177811. "bits": [ 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  177812. "attributes": {
  177813. "hdlname": "cpu_I _zz_240_",
  177814. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:467.23-467.31"
  177815. }
  177816. },
  177817. "cpu_I._zz_241_": {
  177818. "hide_name": 0,
  177819. "bits": [ 978, 976, 974, 972, 970, 1000, 998, 996, 990, 968, 946, 943 ],
  177820. "attributes": {
  177821. "hdlname": "cpu_I _zz_241_",
  177822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:468.23-468.31"
  177823. }
  177824. },
  177825. "cpu_I._zz_246_": {
  177826. "hide_name": 0,
  177827. "bits": [ 2991, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  177828. "attributes": {
  177829. "hdlname": "cpu_I _zz_246_",
  177830. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:473.23-473.31"
  177831. }
  177832. },
  177833. "cpu_I._zz_247_": {
  177834. "hide_name": 0,
  177835. "bits": [ "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  177836. "attributes": {
  177837. "hdlname": "cpu_I _zz_247_",
  177838. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:474.23-474.31"
  177839. }
  177840. },
  177841. "cpu_I._zz_248_": {
  177842. "hide_name": 0,
  177843. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  177844. "attributes": {
  177845. "hdlname": "cpu_I _zz_248_",
  177846. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:475.23-475.31"
  177847. }
  177848. },
  177849. "cpu_I._zz_249_": {
  177850. "hide_name": 0,
  177851. "bits": [ 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  177852. "attributes": {
  177853. "hdlname": "cpu_I _zz_249_",
  177854. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:476.23-476.31"
  177855. }
  177856. },
  177857. "cpu_I._zz_24_": {
  177858. "hide_name": 0,
  177859. "bits": [ 3294, 3291 ],
  177860. "attributes": {
  177861. "hdlname": "cpu_I _zz_24_",
  177862. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:720.20-720.27"
  177863. }
  177864. },
  177865. "cpu_I._zz_250_": {
  177866. "hide_name": 0,
  177867. "bits": [ 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 950, 966, 964, 962, 960, 958, 956, 954, 952, 943 ],
  177868. "attributes": {
  177869. "hdlname": "cpu_I _zz_250_",
  177870. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:477.23-477.31"
  177871. }
  177872. },
  177873. "cpu_I._zz_251_": {
  177874. "hide_name": 0,
  177875. "bits": [ 976, 974, 972, 970, 1000, 998, 996, 990, 968, 946, 978, 943 ],
  177876. "attributes": {
  177877. "hdlname": "cpu_I _zz_251_",
  177878. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:478.23-478.31"
  177879. }
  177880. },
  177881. "cpu_I._zz_252_": {
  177882. "hide_name": 0,
  177883. "bits": [ 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  177884. "attributes": {
  177885. "hdlname": "cpu_I _zz_252_",
  177886. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:479.23-479.31"
  177887. }
  177888. },
  177889. "cpu_I._zz_253_": {
  177890. "hide_name": 0,
  177891. "bits": [ "0", 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 950, 966, 964, 962, 960, 958, 956, 954, 952, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  177892. "attributes": {
  177893. "hdlname": "cpu_I _zz_253_",
  177894. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:480.23-480.31"
  177895. }
  177896. },
  177897. "cpu_I._zz_254_": {
  177898. "hide_name": 0,
  177899. "bits": [ "0", 976, 974, 972, 970, 1000, 998, 996, 990, 968, 946, 978, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943, 943 ],
  177900. "attributes": {
  177901. "hdlname": "cpu_I _zz_254_",
  177902. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:481.23-481.31"
  177903. }
  177904. },
  177905. "cpu_I._zz_255_": {
  177906. "hide_name": 0,
  177907. "bits": [ 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  177908. "attributes": {
  177909. "hdlname": "cpu_I _zz_255_",
  177910. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:482.23-482.31"
  177911. }
  177912. },
  177913. "cpu_I._zz_256_": {
  177914. "hide_name": 0,
  177915. "bits": [ 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 950, 966, 964, 962, 960, 958, 956, 954, 952, 943 ],
  177916. "attributes": {
  177917. "hdlname": "cpu_I _zz_256_",
  177918. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:483.23-483.31"
  177919. }
  177920. },
  177921. "cpu_I._zz_257_": {
  177922. "hide_name": 0,
  177923. "bits": [ 976, 974, 972, 970, 1000, 998, 996, 990, 968, 946, 978, 943 ],
  177924. "attributes": {
  177925. "hdlname": "cpu_I _zz_257_",
  177926. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:484.23-484.31"
  177927. }
  177928. },
  177929. "cpu_I._zz_258_": {
  177930. "hide_name": 0,
  177931. "bits": [ "0", "0", "1" ],
  177932. "attributes": {
  177933. "hdlname": "cpu_I _zz_258_",
  177934. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:485.23-485.31"
  177935. }
  177936. },
  177937. "cpu_I._zz_259_": {
  177938. "hide_name": 0,
  177939. "bits": [ 3569, 3491, 3477, 3465, 3452, 3433, 3631, 3408, 3391, 3374, 3562, 3543, 3533, 3523, 3512, 3503, 3415, 3550, 3575, 3584, 3592, 3600, 3609, 3618, 3626, 3307, 3321, 3329, 3338, 3347, 3356, 3365, 3493, 3480, 3468, 3455, 3439, 3435, 3411, 3394, 3380, 3376, 3546, 3536, 3526, 3515, 3506, 3421, 3417, 3552, 3577, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310, 3310 ],
  177940. "attributes": {
  177941. "hdlname": "cpu_I _zz_259_",
  177942. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:486.23-486.31"
  177943. }
  177944. },
  177945. "cpu_I._zz_25_": {
  177946. "hide_name": 0,
  177947. "bits": [ 1822, 1823 ],
  177948. "attributes": {
  177949. "hdlname": "cpu_I _zz_25_",
  177950. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:726.20-726.27"
  177951. }
  177952. },
  177953. "cpu_I._zz_260_": {
  177954. "hide_name": 0,
  177955. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 3494, 3481, 3469, 3456, 3440, 3436, 3412, 3395, 3381, 3377, 3547, 3537, 3527, 3516, 3507, 3422, 3418, 3553, 3578, 3586, 3594, 3602, 3611, 3620, 3314, 3311, 3323, 3331, 3340, 3349, 3358, 3367, "x", "x" ],
  177956. "attributes": {
  177957. "hdlname": "cpu_I _zz_260_",
  177958. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:487.23-487.31"
  177959. }
  177960. },
  177961. "cpu_I._zz_261_": {
  177962. "hide_name": 0,
  177963. "bits": [ 3569, 3491, 3477, 3465, 3452, 3433, 3631, 3408, 3391, 3374, 3562, 3543, 3533, 3523, 3512, 3503, 3415, 3550, 3575, 3584, 3592, 3600, 3609, 3618, 3626, 3307, 3321, 3329, 3338, 3347, 3356, 3365 ],
  177964. "attributes": {
  177965. "hdlname": "cpu_I _zz_261_",
  177966. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:488.23-488.31"
  177967. }
  177968. },
  177969. "cpu_I._zz_264_": {
  177970. "hide_name": 0,
  177971. "bits": [ 7068, "0", "0", "0", "0", "0" ],
  177972. "attributes": {
  177973. "hdlname": "cpu_I _zz_264_",
  177974. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:491.23-491.31",
  177975. "unused_bits": "0 "
  177976. }
  177977. },
  177978. "cpu_I._zz_265_": {
  177979. "hide_name": 0,
  177980. "bits": [ 5151, 5188, 5202, 5205, 5208, 5211, 5214, 5220, 5223, 5241, 5180, 5215, 5224, 5227, 5230, 5233, 5236, 5239, 5240, 5154, 5159, 5162, 5199, 5167, 5170, 5173, 5176, 5179, 5185, 5191, 5194, 5197, "0" ],
  177981. "attributes": {
  177982. "hdlname": "cpu_I _zz_265_",
  177983. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:492.23-492.31"
  177984. }
  177985. },
  177986. "cpu_I._zz_267_": {
  177987. "hide_name": 0,
  177988. "bits": [ 2752, 2719, 2667, 2684, 2689, 2694, 2699, 2704, 2709, 2717, 2652, 2711, 2721, 2726, 2731, 2736, 2741, 2746, 2749, 2601, 2610, 2615, 2620, 2625, 2630, 2635, 2640, 2645, 2650, 2662, 2674, 2679 ],
  177989. "attributes": {
  177990. "hdlname": "cpu_I _zz_267_",
  177991. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:494.23-494.31"
  177992. }
  177993. },
  177994. "cpu_I._zz_268_": {
  177995. "hide_name": 0,
  177996. "bits": [ 7069, 2720, 2668, 2685, 2690, 2695, 2700, 2705, 2710, 2718, 2653, 2712, 2722, 2727, 2732, 2737, 2742, 2747, 2750, 2603, 2611, 2616, 2621, 2626, 2631, 2636, 2641, 2646, 2651, 2663, 2675, 2680, 2752 ],
  177997. "attributes": {
  177998. "hdlname": "cpu_I _zz_268_",
  177999. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:495.23-495.31",
  178000. "unused_bits": "0 "
  178001. }
  178002. },
  178003. "cpu_I._zz_269_": {
  178004. "hide_name": 0,
  178005. "bits": [ 2670, 2666, 2683, 2688, 2693, 2698, 2703, 2708, 2716, 2597, 2658, 2715, 2725, 2730, 2735, 2740, 2745, 2748, 2600, 2609, 2614, 2619, 2624, 2629, 2634, 2639, 2644, 2649, 2661, 2673, 2678, 2594, "x" ],
  178006. "attributes": {
  178007. "hdlname": "cpu_I _zz_269_",
  178008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:496.23-496.31"
  178009. }
  178010. },
  178011. "cpu_I._zz_269__SB_LUT4_O_10_I2": {
  178012. "hide_name": 0,
  178013. "bits": [ "0", "0", 2598, 2599 ],
  178014. "attributes": {
  178015. "force_downto": "00000000000000000000000000000001",
  178016. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178017. }
  178018. },
  178019. "cpu_I._zz_269__SB_LUT4_O_10_I3": {
  178020. "hide_name": 0,
  178021. "bits": [ 2599 ],
  178022. "attributes": {
  178023. "abc9_carry": "00000000000000000000000000000001",
  178024. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178025. }
  178026. },
  178027. "cpu_I._zz_269__SB_LUT4_O_11_I2": {
  178028. "hide_name": 0,
  178029. "bits": [ "0", "0", 2607, 2608 ],
  178030. "attributes": {
  178031. "force_downto": "00000000000000000000000000000001",
  178032. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178033. }
  178034. },
  178035. "cpu_I._zz_269__SB_LUT4_O_11_I3": {
  178036. "hide_name": 0,
  178037. "bits": [ 2608 ],
  178038. "attributes": {
  178039. "abc9_carry": "00000000000000000000000000000001",
  178040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178041. }
  178042. },
  178043. "cpu_I._zz_269__SB_LUT4_O_12_I2": {
  178044. "hide_name": 0,
  178045. "bits": [ "0", "0", 2612, 2613 ],
  178046. "attributes": {
  178047. "force_downto": "00000000000000000000000000000001",
  178048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178049. }
  178050. },
  178051. "cpu_I._zz_269__SB_LUT4_O_12_I3": {
  178052. "hide_name": 0,
  178053. "bits": [ 2613 ],
  178054. "attributes": {
  178055. "abc9_carry": "00000000000000000000000000000001",
  178056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178057. }
  178058. },
  178059. "cpu_I._zz_269__SB_LUT4_O_13_I2": {
  178060. "hide_name": 0,
  178061. "bits": [ "0", "0", 2617, 2618 ],
  178062. "attributes": {
  178063. "force_downto": "00000000000000000000000000000001",
  178064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178065. }
  178066. },
  178067. "cpu_I._zz_269__SB_LUT4_O_13_I3": {
  178068. "hide_name": 0,
  178069. "bits": [ 2618 ],
  178070. "attributes": {
  178071. "abc9_carry": "00000000000000000000000000000001",
  178072. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178073. }
  178074. },
  178075. "cpu_I._zz_269__SB_LUT4_O_14_I2": {
  178076. "hide_name": 0,
  178077. "bits": [ "0", "0", 2622, 2623 ],
  178078. "attributes": {
  178079. "force_downto": "00000000000000000000000000000001",
  178080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178081. }
  178082. },
  178083. "cpu_I._zz_269__SB_LUT4_O_14_I3": {
  178084. "hide_name": 0,
  178085. "bits": [ 2623 ],
  178086. "attributes": {
  178087. "abc9_carry": "00000000000000000000000000000001",
  178088. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178089. }
  178090. },
  178091. "cpu_I._zz_269__SB_LUT4_O_15_I2": {
  178092. "hide_name": 0,
  178093. "bits": [ "0", "0", 2627, 2628 ],
  178094. "attributes": {
  178095. "force_downto": "00000000000000000000000000000001",
  178096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178097. }
  178098. },
  178099. "cpu_I._zz_269__SB_LUT4_O_15_I3": {
  178100. "hide_name": 0,
  178101. "bits": [ 2628 ],
  178102. "attributes": {
  178103. "abc9_carry": "00000000000000000000000000000001",
  178104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178105. }
  178106. },
  178107. "cpu_I._zz_269__SB_LUT4_O_16_I2": {
  178108. "hide_name": 0,
  178109. "bits": [ "0", "0", 2632, 2633 ],
  178110. "attributes": {
  178111. "force_downto": "00000000000000000000000000000001",
  178112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178113. }
  178114. },
  178115. "cpu_I._zz_269__SB_LUT4_O_16_I3": {
  178116. "hide_name": 0,
  178117. "bits": [ 2633 ],
  178118. "attributes": {
  178119. "abc9_carry": "00000000000000000000000000000001",
  178120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178121. }
  178122. },
  178123. "cpu_I._zz_269__SB_LUT4_O_17_I2": {
  178124. "hide_name": 0,
  178125. "bits": [ "0", "0", 2637, 2638 ],
  178126. "attributes": {
  178127. "force_downto": "00000000000000000000000000000001",
  178128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178129. }
  178130. },
  178131. "cpu_I._zz_269__SB_LUT4_O_17_I3": {
  178132. "hide_name": 0,
  178133. "bits": [ 2638 ],
  178134. "attributes": {
  178135. "abc9_carry": "00000000000000000000000000000001",
  178136. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178137. }
  178138. },
  178139. "cpu_I._zz_269__SB_LUT4_O_18_I2": {
  178140. "hide_name": 0,
  178141. "bits": [ "0", "0", 2642, 2643 ],
  178142. "attributes": {
  178143. "force_downto": "00000000000000000000000000000001",
  178144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178145. }
  178146. },
  178147. "cpu_I._zz_269__SB_LUT4_O_18_I3": {
  178148. "hide_name": 0,
  178149. "bits": [ 2643 ],
  178150. "attributes": {
  178151. "abc9_carry": "00000000000000000000000000000001",
  178152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178153. }
  178154. },
  178155. "cpu_I._zz_269__SB_LUT4_O_19_I2": {
  178156. "hide_name": 0,
  178157. "bits": [ "0", "0", 2647, 2648 ],
  178158. "attributes": {
  178159. "force_downto": "00000000000000000000000000000001",
  178160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178161. }
  178162. },
  178163. "cpu_I._zz_269__SB_LUT4_O_19_I3": {
  178164. "hide_name": 0,
  178165. "bits": [ 2648 ],
  178166. "attributes": {
  178167. "abc9_carry": "00000000000000000000000000000001",
  178168. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178169. }
  178170. },
  178171. "cpu_I._zz_269__SB_LUT4_O_1_I2": {
  178172. "hide_name": 0,
  178173. "bits": [ "0", "0", 2595, 2596 ],
  178174. "attributes": {
  178175. "force_downto": "00000000000000000000000000000001",
  178176. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178177. }
  178178. },
  178179. "cpu_I._zz_269__SB_LUT4_O_1_I3": {
  178180. "hide_name": 0,
  178181. "bits": [ 2596 ],
  178182. "attributes": {
  178183. "abc9_carry": "00000000000000000000000000000001",
  178184. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178185. }
  178186. },
  178187. "cpu_I._zz_269__SB_LUT4_O_20_I2": {
  178188. "hide_name": 0,
  178189. "bits": [ "0", "0", 2659, 2660 ],
  178190. "attributes": {
  178191. "force_downto": "00000000000000000000000000000001",
  178192. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178193. }
  178194. },
  178195. "cpu_I._zz_269__SB_LUT4_O_20_I3": {
  178196. "hide_name": 0,
  178197. "bits": [ 2660 ],
  178198. "attributes": {
  178199. "abc9_carry": "00000000000000000000000000000001",
  178200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178201. }
  178202. },
  178203. "cpu_I._zz_269__SB_LUT4_O_21_I2": {
  178204. "hide_name": 0,
  178205. "bits": [ "0", "0", 2664, 2665 ],
  178206. "attributes": {
  178207. "force_downto": "00000000000000000000000000000001",
  178208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178209. }
  178210. },
  178211. "cpu_I._zz_269__SB_LUT4_O_21_I3": {
  178212. "hide_name": 0,
  178213. "bits": [ 2665 ],
  178214. "attributes": {
  178215. "abc9_carry": "00000000000000000000000000000001",
  178216. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178217. }
  178218. },
  178219. "cpu_I._zz_269__SB_LUT4_O_21_I3_SB_CARRY_CO_I1": {
  178220. "hide_name": 0,
  178221. "bits": [ 2669 ],
  178222. "attributes": {
  178223. }
  178224. },
  178225. "cpu_I._zz_269__SB_LUT4_O_22_I2": {
  178226. "hide_name": 0,
  178227. "bits": [ "0", "0", 2671, 2672 ],
  178228. "attributes": {
  178229. "force_downto": "00000000000000000000000000000001",
  178230. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178231. }
  178232. },
  178233. "cpu_I._zz_269__SB_LUT4_O_22_I3": {
  178234. "hide_name": 0,
  178235. "bits": [ 2672 ],
  178236. "attributes": {
  178237. "abc9_carry": "00000000000000000000000000000001",
  178238. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178239. }
  178240. },
  178241. "cpu_I._zz_269__SB_LUT4_O_23_I2": {
  178242. "hide_name": 0,
  178243. "bits": [ "0", "0", 2676, 2677 ],
  178244. "attributes": {
  178245. "force_downto": "00000000000000000000000000000001",
  178246. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178247. }
  178248. },
  178249. "cpu_I._zz_269__SB_LUT4_O_23_I3": {
  178250. "hide_name": 0,
  178251. "bits": [ 2677 ],
  178252. "attributes": {
  178253. "abc9_carry": "00000000000000000000000000000001",
  178254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178255. }
  178256. },
  178257. "cpu_I._zz_269__SB_LUT4_O_24_I2": {
  178258. "hide_name": 0,
  178259. "bits": [ "0", "0", 2681, 2682 ],
  178260. "attributes": {
  178261. "force_downto": "00000000000000000000000000000001",
  178262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178263. }
  178264. },
  178265. "cpu_I._zz_269__SB_LUT4_O_24_I3": {
  178266. "hide_name": 0,
  178267. "bits": [ 2682 ],
  178268. "attributes": {
  178269. "abc9_carry": "00000000000000000000000000000001",
  178270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178271. }
  178272. },
  178273. "cpu_I._zz_269__SB_LUT4_O_25_I2": {
  178274. "hide_name": 0,
  178275. "bits": [ "0", "0", 2686, 2687 ],
  178276. "attributes": {
  178277. "force_downto": "00000000000000000000000000000001",
  178278. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178279. }
  178280. },
  178281. "cpu_I._zz_269__SB_LUT4_O_25_I3": {
  178282. "hide_name": 0,
  178283. "bits": [ 2687 ],
  178284. "attributes": {
  178285. "abc9_carry": "00000000000000000000000000000001",
  178286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178287. }
  178288. },
  178289. "cpu_I._zz_269__SB_LUT4_O_26_I2": {
  178290. "hide_name": 0,
  178291. "bits": [ "0", "0", 2691, 2692 ],
  178292. "attributes": {
  178293. "force_downto": "00000000000000000000000000000001",
  178294. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178295. }
  178296. },
  178297. "cpu_I._zz_269__SB_LUT4_O_26_I3": {
  178298. "hide_name": 0,
  178299. "bits": [ 2692 ],
  178300. "attributes": {
  178301. "abc9_carry": "00000000000000000000000000000001",
  178302. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178303. }
  178304. },
  178305. "cpu_I._zz_269__SB_LUT4_O_27_I2": {
  178306. "hide_name": 0,
  178307. "bits": [ "0", "0", 2696, 2697 ],
  178308. "attributes": {
  178309. "force_downto": "00000000000000000000000000000001",
  178310. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178311. }
  178312. },
  178313. "cpu_I._zz_269__SB_LUT4_O_27_I3": {
  178314. "hide_name": 0,
  178315. "bits": [ 2697 ],
  178316. "attributes": {
  178317. "abc9_carry": "00000000000000000000000000000001",
  178318. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178319. }
  178320. },
  178321. "cpu_I._zz_269__SB_LUT4_O_28_I2": {
  178322. "hide_name": 0,
  178323. "bits": [ "0", "0", 2701, 2702 ],
  178324. "attributes": {
  178325. "force_downto": "00000000000000000000000000000001",
  178326. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178327. }
  178328. },
  178329. "cpu_I._zz_269__SB_LUT4_O_28_I3": {
  178330. "hide_name": 0,
  178331. "bits": [ 2702 ],
  178332. "attributes": {
  178333. "abc9_carry": "00000000000000000000000000000001",
  178334. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178335. }
  178336. },
  178337. "cpu_I._zz_269__SB_LUT4_O_29_I2": {
  178338. "hide_name": 0,
  178339. "bits": [ "0", "0", 2706, 2707 ],
  178340. "attributes": {
  178341. "force_downto": "00000000000000000000000000000001",
  178342. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178343. }
  178344. },
  178345. "cpu_I._zz_269__SB_LUT4_O_29_I3": {
  178346. "hide_name": 0,
  178347. "bits": [ 2707 ],
  178348. "attributes": {
  178349. "abc9_carry": "00000000000000000000000000000001",
  178350. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178351. }
  178352. },
  178353. "cpu_I._zz_269__SB_LUT4_O_2_I2": {
  178354. "hide_name": 0,
  178355. "bits": [ "0", "0", 2656, 2657 ],
  178356. "attributes": {
  178357. "force_downto": "00000000000000000000000000000001",
  178358. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178359. }
  178360. },
  178361. "cpu_I._zz_269__SB_LUT4_O_2_I3": {
  178362. "hide_name": 0,
  178363. "bits": [ 2657 ],
  178364. "attributes": {
  178365. "abc9_carry": "00000000000000000000000000000001",
  178366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178367. }
  178368. },
  178369. "cpu_I._zz_269__SB_LUT4_O_30_I2": {
  178370. "hide_name": 0,
  178371. "bits": [ "0", "0", 2655, 2654 ],
  178372. "attributes": {
  178373. "force_downto": "00000000000000000000000000000001",
  178374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178375. }
  178376. },
  178377. "cpu_I._zz_269__SB_LUT4_O_30_I3": {
  178378. "hide_name": 0,
  178379. "bits": [ 2654 ],
  178380. "attributes": {
  178381. "abc9_carry": "00000000000000000000000000000001",
  178382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178383. }
  178384. },
  178385. "cpu_I._zz_269__SB_LUT4_O_3_I2": {
  178386. "hide_name": 0,
  178387. "bits": [ "0", "0", 2713, 2714 ],
  178388. "attributes": {
  178389. "force_downto": "00000000000000000000000000000001",
  178390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178391. }
  178392. },
  178393. "cpu_I._zz_269__SB_LUT4_O_3_I3": {
  178394. "hide_name": 0,
  178395. "bits": [ 2714 ],
  178396. "attributes": {
  178397. "abc9_carry": "00000000000000000000000000000001",
  178398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178399. }
  178400. },
  178401. "cpu_I._zz_269__SB_LUT4_O_4_I2": {
  178402. "hide_name": 0,
  178403. "bits": [ "0", "0", 2723, 2724 ],
  178404. "attributes": {
  178405. "force_downto": "00000000000000000000000000000001",
  178406. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178407. }
  178408. },
  178409. "cpu_I._zz_269__SB_LUT4_O_4_I3": {
  178410. "hide_name": 0,
  178411. "bits": [ 2724 ],
  178412. "attributes": {
  178413. "abc9_carry": "00000000000000000000000000000001",
  178414. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178415. }
  178416. },
  178417. "cpu_I._zz_269__SB_LUT4_O_5_I2": {
  178418. "hide_name": 0,
  178419. "bits": [ "0", "0", 2728, 2729 ],
  178420. "attributes": {
  178421. "force_downto": "00000000000000000000000000000001",
  178422. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178423. }
  178424. },
  178425. "cpu_I._zz_269__SB_LUT4_O_5_I3": {
  178426. "hide_name": 0,
  178427. "bits": [ 2729 ],
  178428. "attributes": {
  178429. "abc9_carry": "00000000000000000000000000000001",
  178430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178431. }
  178432. },
  178433. "cpu_I._zz_269__SB_LUT4_O_6_I2": {
  178434. "hide_name": 0,
  178435. "bits": [ "0", "0", 2733, 2734 ],
  178436. "attributes": {
  178437. "force_downto": "00000000000000000000000000000001",
  178438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178439. }
  178440. },
  178441. "cpu_I._zz_269__SB_LUT4_O_6_I3": {
  178442. "hide_name": 0,
  178443. "bits": [ 2734 ],
  178444. "attributes": {
  178445. "abc9_carry": "00000000000000000000000000000001",
  178446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178447. }
  178448. },
  178449. "cpu_I._zz_269__SB_LUT4_O_7_I2": {
  178450. "hide_name": 0,
  178451. "bits": [ "0", "0", 2738, 2739 ],
  178452. "attributes": {
  178453. "force_downto": "00000000000000000000000000000001",
  178454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178455. }
  178456. },
  178457. "cpu_I._zz_269__SB_LUT4_O_7_I3": {
  178458. "hide_name": 0,
  178459. "bits": [ 2739 ],
  178460. "attributes": {
  178461. "abc9_carry": "00000000000000000000000000000001",
  178462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178463. }
  178464. },
  178465. "cpu_I._zz_269__SB_LUT4_O_8_I2": {
  178466. "hide_name": 0,
  178467. "bits": [ "0", "0", 2743, 2744 ],
  178468. "attributes": {
  178469. "force_downto": "00000000000000000000000000000001",
  178470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178471. }
  178472. },
  178473. "cpu_I._zz_269__SB_LUT4_O_8_I3": {
  178474. "hide_name": 0,
  178475. "bits": [ 2744 ],
  178476. "attributes": {
  178477. "abc9_carry": "00000000000000000000000000000001",
  178478. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178479. }
  178480. },
  178481. "cpu_I._zz_269__SB_LUT4_O_9_I2": {
  178482. "hide_name": 0,
  178483. "bits": [ "0", "0", 2606, 2605 ],
  178484. "attributes": {
  178485. "force_downto": "00000000000000000000000000000001",
  178486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178487. }
  178488. },
  178489. "cpu_I._zz_269__SB_LUT4_O_9_I3": {
  178490. "hide_name": 0,
  178491. "bits": [ 2605 ],
  178492. "attributes": {
  178493. "abc9_carry": "00000000000000000000000000000001",
  178494. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178495. }
  178496. },
  178497. "cpu_I._zz_269__SB_LUT4_O_I2": {
  178498. "hide_name": 0,
  178499. "bits": [ "0", "0", 2592, 2593 ],
  178500. "attributes": {
  178501. "force_downto": "00000000000000000000000000000001",
  178502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178503. }
  178504. },
  178505. "cpu_I._zz_269__SB_LUT4_O_I3": {
  178506. "hide_name": 0,
  178507. "bits": [ 2593 ],
  178508. "attributes": {
  178509. "abc9_carry": "00000000000000000000000000000001",
  178510. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1527.22-1527.99|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  178511. }
  178512. },
  178513. "cpu_I._zz_26_": {
  178514. "hide_name": 0,
  178515. "bits": [ 1822, 1823 ],
  178516. "attributes": {
  178517. "hdlname": "cpu_I _zz_26_",
  178518. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:727.20-727.27"
  178519. }
  178520. },
  178521. "cpu_I._zz_270_": {
  178522. "hide_name": 0,
  178523. "bits": [ 2670, 2666, 2683, 2688, 2693, 2698, 2703, 2708, 2716, 2597, 2658, 2715, 2725, 2730, 2735, 2740, 2745, 2748, 2600, 2609, 2614, 2619, 2624, 2629, 2634, 2639, 2644, 2649, 2661, 2673, 2678, 2594, "x" ],
  178524. "attributes": {
  178525. "hdlname": "cpu_I _zz_270_",
  178526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:497.23-497.31"
  178527. }
  178528. },
  178529. "cpu_I._zz_271_": {
  178530. "hide_name": 0,
  178531. "bits": [ 2670, 2666, 2683, 2688, 2693, 2698, 2703, 2708, 2716, 2597, 2658, 2715, 2725, 2730, 2735, 2740, 2745, 2748, 2600, 2609, 2614, 2619, 2624, 2629, 2634, 2639, 2644, 2649, 2661, 2673, 2678, 2594, "x" ],
  178532. "attributes": {
  178533. "hdlname": "cpu_I _zz_271_",
  178534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:498.23-498.31"
  178535. }
  178536. },
  178537. "cpu_I._zz_272_": {
  178538. "hide_name": 0,
  178539. "bits": [ 2604 ],
  178540. "attributes": {
  178541. "hdlname": "cpu_I _zz_272_",
  178542. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:499.23-499.31"
  178543. }
  178544. },
  178545. "cpu_I._zz_273_": {
  178546. "hide_name": 0,
  178547. "bits": [ 2604, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  178548. "attributes": {
  178549. "hdlname": "cpu_I _zz_273_",
  178550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:500.23-500.31"
  178551. }
  178552. },
  178553. "cpu_I._zz_275_": {
  178554. "hide_name": 0,
  178555. "bits": [ 7070, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  178556. "attributes": {
  178557. "hdlname": "cpu_I _zz_275_",
  178558. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:502.23-502.31",
  178559. "unused_bits": "0 "
  178560. }
  178561. },
  178562. "cpu_I._zz_277_": {
  178563. "hide_name": 0,
  178564. "bits": [ 7071, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  178565. "attributes": {
  178566. "hdlname": "cpu_I _zz_277_",
  178567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:504.23-504.31",
  178568. "unused_bits": "0 "
  178569. }
  178570. },
  178571. "cpu_I._zz_278_": {
  178572. "hide_name": 0,
  178573. "bits": [ 1223 ],
  178574. "attributes": {
  178575. "hdlname": "cpu_I _zz_278_",
  178576. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:505.23-505.31"
  178577. }
  178578. },
  178579. "cpu_I._zz_278__SB_DFFER_D_Q": {
  178580. "hide_name": 0,
  178581. "bits": [ 1107, 1037, 1043, 2753 ],
  178582. "attributes": {
  178583. "force_downto": "00000000000000000000000000000001",
  178584. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178585. }
  178586. },
  178587. "cpu_I._zz_278__SB_LUT4_O_I2": {
  178588. "hide_name": 0,
  178589. "bits": [ 2378, 2473, 2474 ],
  178590. "attributes": {
  178591. "force_downto": "00000000000000000000000000000001",
  178592. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178593. }
  178594. },
  178595. "cpu_I._zz_278__SB_LUT4_O_I3": {
  178596. "hide_name": 0,
  178597. "bits": [ 2858, 2755, 2762 ],
  178598. "attributes": {
  178599. "force_downto": "00000000000000000000000000000001",
  178600. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178601. }
  178602. },
  178603. "cpu_I._zz_278__SB_LUT4_O_I3_SB_LUT4_O_1_I2": {
  178604. "hide_name": 0,
  178605. "bits": [ 1246, 1247, 2760, 2761 ],
  178606. "attributes": {
  178607. "force_downto": "00000000000000000000000000000001",
  178608. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178609. }
  178610. },
  178611. "cpu_I._zz_278__SB_LUT4_O_I3_SB_LUT4_O_I3": {
  178612. "hide_name": 0,
  178613. "bits": [ 1173, 1034, 2754 ],
  178614. "attributes": {
  178615. "force_downto": "00000000000000000000000000000001",
  178616. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178617. }
  178618. },
  178619. "cpu_I._zz_279_": {
  178620. "hide_name": 0,
  178621. "bits": [ 2763 ],
  178622. "attributes": {
  178623. "hdlname": "cpu_I _zz_279_",
  178624. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:506.23-506.31"
  178625. }
  178626. },
  178627. "cpu_I._zz_279__SB_DFFER_D_Q": {
  178628. "hide_name": 0,
  178629. "bits": [ 1037, 1029, 2764, 2765 ],
  178630. "attributes": {
  178631. "force_downto": "00000000000000000000000000000001",
  178632. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178633. }
  178634. },
  178635. "cpu_I._zz_279__SB_LUT4_I2_I3": {
  178636. "hide_name": 0,
  178637. "bits": [ 2261, 2763, 2766 ],
  178638. "attributes": {
  178639. "force_downto": "00000000000000000000000000000001",
  178640. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178641. }
  178642. },
  178643. "cpu_I._zz_279__SB_LUT4_I2_O": {
  178644. "hide_name": 0,
  178645. "bits": [ 2767 ],
  178646. "attributes": {
  178647. }
  178648. },
  178649. "cpu_I._zz_279__SB_LUT4_I2_O_SB_DFFR_D_Q": {
  178650. "hide_name": 0,
  178651. "bits": [ 2260, 2035, 1475 ],
  178652. "attributes": {
  178653. "force_downto": "00000000000000000000000000000001",
  178654. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178655. }
  178656. },
  178657. "cpu_I._zz_279__SB_LUT4_O_I2": {
  178658. "hide_name": 0,
  178659. "bits": [ 2378, 2469, 2470 ],
  178660. "attributes": {
  178661. "force_downto": "00000000000000000000000000000001",
  178662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178663. }
  178664. },
  178665. "cpu_I._zz_27_": {
  178666. "hide_name": 0,
  178667. "bits": [ 4907, 4906 ],
  178668. "attributes": {
  178669. "hdlname": "cpu_I _zz_27_",
  178670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:752.20-752.27"
  178671. }
  178672. },
  178673. "cpu_I._zz_280_": {
  178674. "hide_name": 0,
  178675. "bits": [ 2262 ],
  178676. "attributes": {
  178677. "hdlname": "cpu_I _zz_280_",
  178678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:507.23-507.31"
  178679. }
  178680. },
  178681. "cpu_I._zz_280__SB_DFFER_D_Q": {
  178682. "hide_name": 0,
  178683. "bits": [ 1037, 1029, 2772, 2773 ],
  178684. "attributes": {
  178685. "force_downto": "00000000000000000000000000000001",
  178686. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178687. }
  178688. },
  178689. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_I2_O": {
  178690. "hide_name": 0,
  178691. "bits": [ 2858, 2774, 2777, 2780 ],
  178692. "attributes": {
  178693. "force_downto": "00000000000000000000000000000001",
  178694. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178695. }
  178696. },
  178697. "cpu_I._zz_280__SB_DFFER_D_Q_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  178698. "hide_name": 0,
  178699. "bits": [ 1246, 1247, 2775, 2776 ],
  178700. "attributes": {
  178701. "force_downto": "00000000000000000000000000000001",
  178702. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178703. }
  178704. },
  178705. "cpu_I._zz_280__SB_LUT4_I2_O": {
  178706. "hide_name": 0,
  178707. "bits": [ 1112, 1110, 1106, 1105, 1103, 1101, 1099, 1097, 1095, 1093, 1091, 1089, 1085, 1083, 1081, 1079, 1077, 1075, 1073, 1071, 1069, 1067, 1124, 1122, 1120, 1118, 1116, 1114, 1108, 1087, 1065, 1064 ],
  178708. "attributes": {
  178709. }
  178710. },
  178711. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_10_I3": {
  178712. "hide_name": 0,
  178713. "bits": [ 2768, 1146, 2785 ],
  178714. "attributes": {
  178715. "force_downto": "00000000000000000000000000000001",
  178716. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178717. }
  178718. },
  178719. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_11_I3": {
  178720. "hide_name": 0,
  178721. "bits": [ 2768, 1203, 2787 ],
  178722. "attributes": {
  178723. "force_downto": "00000000000000000000000000000001",
  178724. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178725. }
  178726. },
  178727. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_12_I3": {
  178728. "hide_name": 0,
  178729. "bits": [ 2768, 1201, 2789 ],
  178730. "attributes": {
  178731. "force_downto": "00000000000000000000000000000001",
  178732. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178733. }
  178734. },
  178735. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_13_I3": {
  178736. "hide_name": 0,
  178737. "bits": [ 2768, 1199, 2791 ],
  178738. "attributes": {
  178739. "force_downto": "00000000000000000000000000000001",
  178740. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178741. }
  178742. },
  178743. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_14_I3": {
  178744. "hide_name": 0,
  178745. "bits": [ 2768, 1197, 2793 ],
  178746. "attributes": {
  178747. "force_downto": "00000000000000000000000000000001",
  178748. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178749. }
  178750. },
  178751. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_15_I3": {
  178752. "hide_name": 0,
  178753. "bits": [ 2768, 1195, 2795 ],
  178754. "attributes": {
  178755. "force_downto": "00000000000000000000000000000001",
  178756. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178757. }
  178758. },
  178759. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_16_I3": {
  178760. "hide_name": 0,
  178761. "bits": [ 2768, 1193, 2797 ],
  178762. "attributes": {
  178763. "force_downto": "00000000000000000000000000000001",
  178764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178765. }
  178766. },
  178767. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_17_I3": {
  178768. "hide_name": 0,
  178769. "bits": [ 2768, 1191, 2799 ],
  178770. "attributes": {
  178771. "force_downto": "00000000000000000000000000000001",
  178772. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178773. }
  178774. },
  178775. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_18_I3": {
  178776. "hide_name": 0,
  178777. "bits": [ 2768, 1189, 2801 ],
  178778. "attributes": {
  178779. "force_downto": "00000000000000000000000000000001",
  178780. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178781. }
  178782. },
  178783. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_19_I3": {
  178784. "hide_name": 0,
  178785. "bits": [ 2768, 1187, 2803 ],
  178786. "attributes": {
  178787. "force_downto": "00000000000000000000000000000001",
  178788. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178789. }
  178790. },
  178791. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_1_I2": {
  178792. "hide_name": 0,
  178793. "bits": [ 2768, 2784, 1039 ],
  178794. "attributes": {
  178795. "force_downto": "00000000000000000000000000000001",
  178796. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178797. }
  178798. },
  178799. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_20_I3": {
  178800. "hide_name": 0,
  178801. "bits": [ 2768, 1237, 2807 ],
  178802. "attributes": {
  178803. "force_downto": "00000000000000000000000000000001",
  178804. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178805. }
  178806. },
  178807. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_21_I3": {
  178808. "hide_name": 0,
  178809. "bits": [ 2768, 1235, 2809 ],
  178810. "attributes": {
  178811. "force_downto": "00000000000000000000000000000001",
  178812. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178813. }
  178814. },
  178815. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_22_I3": {
  178816. "hide_name": 0,
  178817. "bits": [ 2768, 1233, 2811 ],
  178818. "attributes": {
  178819. "force_downto": "00000000000000000000000000000001",
  178820. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178821. }
  178822. },
  178823. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_23_I3": {
  178824. "hide_name": 0,
  178825. "bits": [ 2768, 1231, 2813 ],
  178826. "attributes": {
  178827. "force_downto": "00000000000000000000000000000001",
  178828. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178829. }
  178830. },
  178831. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_24_I3": {
  178832. "hide_name": 0,
  178833. "bits": [ 2768, 1229, 2815 ],
  178834. "attributes": {
  178835. "force_downto": "00000000000000000000000000000001",
  178836. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178837. }
  178838. },
  178839. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_25_I3": {
  178840. "hide_name": 0,
  178841. "bits": [ 2768, 1227, 2817 ],
  178842. "attributes": {
  178843. "force_downto": "00000000000000000000000000000001",
  178844. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178845. }
  178846. },
  178847. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_26_I3": {
  178848. "hide_name": 0,
  178849. "bits": [ 2768, 1225, 2819 ],
  178850. "attributes": {
  178851. "force_downto": "00000000000000000000000000000001",
  178852. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178853. }
  178854. },
  178855. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_27_I3": {
  178856. "hide_name": 0,
  178857. "bits": [ 2768, 1206, 2821 ],
  178858. "attributes": {
  178859. "force_downto": "00000000000000000000000000000001",
  178860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178861. }
  178862. },
  178863. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_28_I3": {
  178864. "hide_name": 0,
  178865. "bits": [ 2768, 1185, 2823 ],
  178866. "attributes": {
  178867. "force_downto": "00000000000000000000000000000001",
  178868. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178869. }
  178870. },
  178871. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_29_I3": {
  178872. "hide_name": 0,
  178873. "bits": [ 2768, 1059, 2825 ],
  178874. "attributes": {
  178875. "force_downto": "00000000000000000000000000000001",
  178876. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178877. }
  178878. },
  178879. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  178880. "hide_name": 0,
  178881. "bits": [ 2768, 1220, 2806 ],
  178882. "attributes": {
  178883. "force_downto": "00000000000000000000000000000001",
  178884. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178885. }
  178886. },
  178887. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  178888. "hide_name": 0,
  178889. "bits": [ 2768, 1218, 2828 ],
  178890. "attributes": {
  178891. "force_downto": "00000000000000000000000000000001",
  178892. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178893. }
  178894. },
  178895. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  178896. "hide_name": 0,
  178897. "bits": [ 2768, 1216, 2830 ],
  178898. "attributes": {
  178899. "force_downto": "00000000000000000000000000000001",
  178900. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178901. }
  178902. },
  178903. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  178904. "hide_name": 0,
  178905. "bits": [ 2768, 1054, 2832 ],
  178906. "attributes": {
  178907. "force_downto": "00000000000000000000000000000001",
  178908. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178909. }
  178910. },
  178911. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_7_I3": {
  178912. "hide_name": 0,
  178913. "bits": [ 2768, 1211, 2835 ],
  178914. "attributes": {
  178915. "force_downto": "00000000000000000000000000000001",
  178916. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178917. }
  178918. },
  178919. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_8_I3": {
  178920. "hide_name": 0,
  178921. "bits": [ 2768, 1209, 2837 ],
  178922. "attributes": {
  178923. "force_downto": "00000000000000000000000000000001",
  178924. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178925. }
  178926. },
  178927. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_9_I3": {
  178928. "hide_name": 0,
  178929. "bits": [ 2768, 1136, 2839 ],
  178930. "attributes": {
  178931. "force_downto": "00000000000000000000000000000001",
  178932. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178933. }
  178934. },
  178935. "cpu_I._zz_280__SB_LUT4_I2_O_SB_LUT4_O_I3": {
  178936. "hide_name": 0,
  178937. "bits": [ 2768, 1223, 2783 ],
  178938. "attributes": {
  178939. "force_downto": "00000000000000000000000000000001",
  178940. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178941. }
  178942. },
  178943. "cpu_I._zz_280__SB_LUT4_O_I2": {
  178944. "hide_name": 0,
  178945. "bits": [ 2378, 1251, 2467 ],
  178946. "attributes": {
  178947. "force_downto": "00000000000000000000000000000001",
  178948. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178949. }
  178950. },
  178951. "cpu_I._zz_281_": {
  178952. "hide_name": 0,
  178953. "bits": [ 1054 ],
  178954. "attributes": {
  178955. "hdlname": "cpu_I _zz_281_",
  178956. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:508.23-508.31"
  178957. }
  178958. },
  178959. "cpu_I._zz_281__SB_LUT4_O_I2": {
  178960. "hide_name": 0,
  178961. "bits": [ 2378, 2386, 2387 ],
  178962. "attributes": {
  178963. "force_downto": "00000000000000000000000000000001",
  178964. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178965. }
  178966. },
  178967. "cpu_I._zz_281__SB_LUT4_O_I2_SB_LUT4_O_1_I3": {
  178968. "hide_name": 0,
  178969. "bits": [ 4115, 2847 ],
  178970. "attributes": {
  178971. "force_downto": "00000000000000000000000000000001",
  178972. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178973. }
  178974. },
  178975. "cpu_I._zz_281__SB_LUT4_O_I3": {
  178976. "hide_name": 0,
  178977. "bits": [ 964, 966, 2387, 2844 ],
  178978. "attributes": {
  178979. "force_downto": "00000000000000000000000000000001",
  178980. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178981. }
  178982. },
  178983. "cpu_I._zz_282_": {
  178984. "hide_name": 0,
  178985. "bits": [ 1039 ],
  178986. "attributes": {
  178987. "hdlname": "cpu_I _zz_282_",
  178988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:509.23-509.31"
  178989. }
  178990. },
  178991. "cpu_I._zz_282__SB_LUT4_O_I2": {
  178992. "hide_name": 0,
  178993. "bits": [ 2378, 2471, 2472 ],
  178994. "attributes": {
  178995. "force_downto": "00000000000000000000000000000001",
  178996. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  178997. }
  178998. },
  178999. "cpu_I._zz_282__SB_LUT4_O_I3": {
  179000. "hide_name": 0,
  179001. "bits": [ 964, 966, 2472, 1129 ],
  179002. "attributes": {
  179003. "force_downto": "00000000000000000000000000000001",
  179004. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179005. }
  179006. },
  179007. "cpu_I._zz_283_": {
  179008. "hide_name": 0,
  179009. "bits": [ 1039 ],
  179010. "attributes": {
  179011. "hdlname": "cpu_I _zz_283_",
  179012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:510.23-510.31"
  179013. }
  179014. },
  179015. "cpu_I._zz_284_": {
  179016. "hide_name": 0,
  179017. "bits": [ 1136 ],
  179018. "attributes": {
  179019. "hdlname": "cpu_I _zz_284_",
  179020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:511.23-511.31"
  179021. }
  179022. },
  179023. "cpu_I._zz_284__SB_LUT4_O_I2": {
  179024. "hide_name": 0,
  179025. "bits": [ 2378, 2398, 2399 ],
  179026. "attributes": {
  179027. "force_downto": "00000000000000000000000000000001",
  179028. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179029. }
  179030. },
  179031. "cpu_I._zz_284__SB_LUT4_O_I3": {
  179032. "hide_name": 0,
  179033. "bits": [ 964, 966, 2399, 2850 ],
  179034. "attributes": {
  179035. "force_downto": "00000000000000000000000000000001",
  179036. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179037. }
  179038. },
  179039. "cpu_I._zz_285_": {
  179040. "hide_name": 0,
  179041. "bits": [ 1054 ],
  179042. "attributes": {
  179043. "hdlname": "cpu_I _zz_285_",
  179044. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:512.23-512.31"
  179045. }
  179046. },
  179047. "cpu_I._zz_286_": {
  179048. "hide_name": 0,
  179049. "bits": [ 1039 ],
  179050. "attributes": {
  179051. "hdlname": "cpu_I _zz_286_",
  179052. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:513.23-513.31"
  179053. }
  179054. },
  179055. "cpu_I._zz_287_": {
  179056. "hide_name": 0,
  179057. "bits": [ 7072, 7073, 7074, 7075, "x", "x", "x" ],
  179058. "attributes": {
  179059. "hdlname": "cpu_I _zz_287_",
  179060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:514.23-514.31",
  179061. "unused_bits": "0 1 2 3"
  179062. }
  179063. },
  179064. "cpu_I._zz_288_": {
  179065. "hide_name": 0,
  179066. "bits": [ "1" ],
  179067. "attributes": {
  179068. "hdlname": "cpu_I _zz_288_",
  179069. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:515.23-515.31"
  179070. }
  179071. },
  179072. "cpu_I._zz_289_": {
  179073. "hide_name": 0,
  179074. "bits": [ "1" ],
  179075. "attributes": {
  179076. "hdlname": "cpu_I _zz_289_",
  179077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:516.23-516.31"
  179078. }
  179079. },
  179080. "cpu_I._zz_28_": {
  179081. "hide_name": 0,
  179082. "bits": [ 1240, 1239 ],
  179083. "attributes": {
  179084. "hdlname": "cpu_I _zz_28_",
  179085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:754.20-754.27"
  179086. }
  179087. },
  179088. "cpu_I._zz_291_": {
  179089. "hide_name": 0,
  179090. "bits": [ 1821 ],
  179091. "attributes": {
  179092. "hdlname": "cpu_I _zz_291_",
  179093. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:518.23-518.31"
  179094. }
  179095. },
  179096. "cpu_I._zz_292_": {
  179097. "hide_name": 0,
  179098. "bits": [ 1821 ],
  179099. "attributes": {
  179100. "hdlname": "cpu_I _zz_292_",
  179101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:519.23-519.31"
  179102. }
  179103. },
  179104. "cpu_I._zz_293_": {
  179105. "hide_name": 0,
  179106. "bits": [ 2853 ],
  179107. "attributes": {
  179108. "hdlname": "cpu_I _zz_293_",
  179109. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:520.23-520.31"
  179110. }
  179111. },
  179112. "cpu_I._zz_293__SB_LUT4_I2_1_I3": {
  179113. "hide_name": 0,
  179114. "bits": [ 1542, 2853, 2854 ],
  179115. "attributes": {
  179116. "force_downto": "00000000000000000000000000000001",
  179117. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179118. }
  179119. },
  179120. "cpu_I._zz_294_": {
  179121. "hide_name": 0,
  179122. "bits": [ "0", "0", "0", "0", "0", 2329, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179123. "attributes": {
  179124. "hdlname": "cpu_I _zz_294_",
  179125. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:521.23-521.31"
  179126. }
  179127. },
  179128. "cpu_I._zz_295_": {
  179129. "hide_name": 0,
  179130. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179131. "attributes": {
  179132. "hdlname": "cpu_I _zz_295_",
  179133. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:522.23-522.31"
  179134. }
  179135. },
  179136. "cpu_I._zz_299_": {
  179137. "hide_name": 0,
  179138. "bits": [ "0", "0" ],
  179139. "attributes": {
  179140. "hdlname": "cpu_I _zz_299_",
  179141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:526.23-526.31"
  179142. }
  179143. },
  179144. "cpu_I._zz_29_": {
  179145. "hide_name": 0,
  179146. "bits": [ 5377, 5376 ],
  179147. "attributes": {
  179148. "hdlname": "cpu_I _zz_29_",
  179149. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:756.20-756.27"
  179150. }
  179151. },
  179152. "cpu_I._zz_2_": {
  179153. "hide_name": 0,
  179154. "bits": [ 2331, 2330 ],
  179155. "attributes": {
  179156. "hdlname": "cpu_I _zz_2_",
  179157. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:676.20-676.26"
  179158. }
  179159. },
  179160. "cpu_I._zz_300_": {
  179161. "hide_name": 0,
  179162. "bits": [ 1822 ],
  179163. "attributes": {
  179164. "hdlname": "cpu_I _zz_300_",
  179165. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:527.23-527.31"
  179166. }
  179167. },
  179168. "cpu_I._zz_301_": {
  179169. "hide_name": 0,
  179170. "bits": [ 2590 ],
  179171. "attributes": {
  179172. "hdlname": "cpu_I _zz_301_",
  179173. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:528.23-528.31"
  179174. }
  179175. },
  179176. "cpu_I._zz_302_": {
  179177. "hide_name": 0,
  179178. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7076, 3287, 3286, 2337, 7077, 2333, 2327, 2341, 7078, 7079, 2340, 3966, 2588, 2857, 2856 ],
  179179. "attributes": {
  179180. "hdlname": "cpu_I _zz_302_",
  179181. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:529.23-529.31",
  179182. "unused_bits": "10 14 18 19"
  179183. }
  179184. },
  179185. "cpu_I._zz_303_": {
  179186. "hide_name": 0,
  179187. "bits": [ "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179188. "attributes": {
  179189. "hdlname": "cpu_I _zz_303_",
  179190. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:530.23-530.31"
  179191. }
  179192. },
  179193. "cpu_I._zz_304_": {
  179194. "hide_name": 0,
  179195. "bits": [ "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179196. "attributes": {
  179197. "hdlname": "cpu_I _zz_304_",
  179198. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:531.23-531.31"
  179199. }
  179200. },
  179201. "cpu_I._zz_305_": {
  179202. "hide_name": 0,
  179203. "bits": [ "0", "0", 2328, 1364, 1543, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179204. "attributes": {
  179205. "hdlname": "cpu_I _zz_305_",
  179206. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:532.23-532.31"
  179207. }
  179208. },
  179209. "cpu_I._zz_306_": {
  179210. "hide_name": 0,
  179211. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179212. "attributes": {
  179213. "hdlname": "cpu_I _zz_306_",
  179214. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:533.23-533.31"
  179215. }
  179216. },
  179217. "cpu_I._zz_307_": {
  179218. "hide_name": 0,
  179219. "bits": [ "0", "0", "0", 1364, 1543, "0", 1363, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179220. "attributes": {
  179221. "hdlname": "cpu_I _zz_307_",
  179222. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:534.23-534.31"
  179223. }
  179224. },
  179225. "cpu_I._zz_308_": {
  179226. "hide_name": 0,
  179227. "bits": [ "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179228. "attributes": {
  179229. "hdlname": "cpu_I _zz_308_",
  179230. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:535.23-535.31"
  179231. }
  179232. },
  179233. "cpu_I._zz_30_": {
  179234. "hide_name": 0,
  179235. "bits": [ 3968, 3967 ],
  179236. "attributes": {
  179237. "hdlname": "cpu_I _zz_30_",
  179238. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:764.20-764.27"
  179239. }
  179240. },
  179241. "cpu_I._zz_312_": {
  179242. "hide_name": 0,
  179243. "bits": [ "0", "0" ],
  179244. "attributes": {
  179245. "hdlname": "cpu_I _zz_312_",
  179246. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:539.23-539.31"
  179247. }
  179248. },
  179249. "cpu_I._zz_313_": {
  179250. "hide_name": 0,
  179251. "bits": [ 2857 ],
  179252. "attributes": {
  179253. "hdlname": "cpu_I _zz_313_",
  179254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:540.23-540.31"
  179255. }
  179256. },
  179257. "cpu_I._zz_314_": {
  179258. "hide_name": 0,
  179259. "bits": [ 2588 ],
  179260. "attributes": {
  179261. "hdlname": "cpu_I _zz_314_",
  179262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:541.23-541.31"
  179263. }
  179264. },
  179265. "cpu_I._zz_315_": {
  179266. "hide_name": 0,
  179267. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7080, 3287, 3286, 2337, 7081, 2333, 2327, 2341, 7082, 7083, 2340, 3966 ],
  179268. "attributes": {
  179269. "hdlname": "cpu_I _zz_315_",
  179270. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:542.23-542.31",
  179271. "unused_bits": "10 14 18 19"
  179272. }
  179273. },
  179274. "cpu_I._zz_316_": {
  179275. "hide_name": 0,
  179276. "bits": [ "0", "0", "0", "0", 1543, "0", "0", "0", "0", "0", "0", "0", 1362, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179277. "attributes": {
  179278. "hdlname": "cpu_I _zz_316_",
  179279. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:543.23-543.31"
  179280. }
  179281. },
  179282. "cpu_I._zz_317_": {
  179283. "hide_name": 0,
  179284. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  179285. "attributes": {
  179286. "hdlname": "cpu_I _zz_317_",
  179287. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:544.23-544.31"
  179288. }
  179289. },
  179290. "cpu_I._zz_31_": {
  179291. "hide_name": 0,
  179292. "bits": [ 2970, 2860, 2861, 2936, 2976, 3003, 3025, 3038, 3050, 3064, 3067, 2863, 2875, 2885, 2888, 2901, 2904, 2916, 2919, 2922, 2925, 2939, 2942, 2945, 2957, 2960, 2963, 2966, 2984, 2980, 2969, 2971 ],
  179293. "attributes": {
  179294. "hdlname": "cpu_I _zz_31_",
  179295. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:767.23-767.30"
  179296. }
  179297. },
  179298. "cpu_I._zz_31__SB_LUT4_O_10_I3": {
  179299. "hide_name": 0,
  179300. "bits": [ 2858, 2850, 2862 ],
  179301. "attributes": {
  179302. "force_downto": "00000000000000000000000000000001",
  179303. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179304. }
  179305. },
  179306. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O_I2": {
  179307. "hide_name": 0,
  179308. "bits": [ 1246, 1247, 2864, 2865 ],
  179309. "attributes": {
  179310. "force_downto": "00000000000000000000000000000001",
  179311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179312. }
  179313. },
  179314. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179315. "hide_name": 0,
  179316. "bits": [ 2991, 2866 ],
  179317. "attributes": {
  179318. "force_downto": "00000000000000000000000000000001",
  179319. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179320. }
  179321. },
  179322. "cpu_I._zz_31__SB_LUT4_O_10_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179323. "hide_name": 0,
  179324. "bits": [ 2867, 2868, 2869 ],
  179325. "attributes": {
  179326. "force_downto": "00000000000000000000000000000001",
  179327. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179328. }
  179329. },
  179330. "cpu_I._zz_31__SB_LUT4_O_11_I3": {
  179331. "hide_name": 0,
  179332. "bits": [ 2858, 2873, 2874 ],
  179333. "attributes": {
  179334. "force_downto": "00000000000000000000000000000001",
  179335. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179336. }
  179337. },
  179338. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2": {
  179339. "hide_name": 0,
  179340. "bits": [ 1246, 1247, 2876, 2877 ],
  179341. "attributes": {
  179342. "force_downto": "00000000000000000000000000000001",
  179343. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179344. }
  179345. },
  179346. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179347. "hide_name": 0,
  179348. "bits": [ 2991, 2878 ],
  179349. "attributes": {
  179350. "force_downto": "00000000000000000000000000000001",
  179351. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179352. }
  179353. },
  179354. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179355. "hide_name": 0,
  179356. "bits": [ 2879, 4875, 4796, 4778 ],
  179357. "attributes": {
  179358. "force_downto": "00000000000000000000000000000001",
  179359. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179360. }
  179361. },
  179362. "cpu_I._zz_31__SB_LUT4_O_11_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179363. "hide_name": 0,
  179364. "bits": [ 2880, 2868, 2881 ],
  179365. "attributes": {
  179366. "force_downto": "00000000000000000000000000000001",
  179367. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179368. }
  179369. },
  179370. "cpu_I._zz_31__SB_LUT4_O_13_I2": {
  179371. "hide_name": 0,
  179372. "bits": [ 964, 966, 2526, 2886 ],
  179373. "attributes": {
  179374. "force_downto": "00000000000000000000000000000001",
  179375. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179376. }
  179377. },
  179378. "cpu_I._zz_31__SB_LUT4_O_13_I2_SB_LUT4_O_I3": {
  179379. "hide_name": 0,
  179380. "bits": [ 1163, 1034, 2889 ],
  179381. "attributes": {
  179382. "force_downto": "00000000000000000000000000000001",
  179383. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179384. }
  179385. },
  179386. "cpu_I._zz_31__SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179387. "hide_name": 0,
  179388. "bits": [ 1082, 1037, 1043, 2890 ],
  179389. "attributes": {
  179390. "force_downto": "00000000000000000000000000000001",
  179391. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179392. }
  179393. },
  179394. "cpu_I._zz_31__SB_LUT4_O_13_I3": {
  179395. "hide_name": 0,
  179396. "bits": [ 2858, 2886, 2887 ],
  179397. "attributes": {
  179398. "force_downto": "00000000000000000000000000000001",
  179399. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179400. }
  179401. },
  179402. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2": {
  179403. "hide_name": 0,
  179404. "bits": [ 1246, 1247, 2891, 2892 ],
  179405. "attributes": {
  179406. "force_downto": "00000000000000000000000000000001",
  179407. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179408. }
  179409. },
  179410. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179411. "hide_name": 0,
  179412. "bits": [ 2991, 2893 ],
  179413. "attributes": {
  179414. "force_downto": "00000000000000000000000000000001",
  179415. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179416. }
  179417. },
  179418. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179419. "hide_name": 0,
  179420. "bits": [ 2525, 4884, 4865, 2895 ],
  179421. "attributes": {
  179422. "force_downto": "00000000000000000000000000000001",
  179423. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179424. }
  179425. },
  179426. "cpu_I._zz_31__SB_LUT4_O_13_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179427. "hide_name": 0,
  179428. "bits": [ 2896, 2868, 2897 ],
  179429. "attributes": {
  179430. "force_downto": "00000000000000000000000000000001",
  179431. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179432. }
  179433. },
  179434. "cpu_I._zz_31__SB_LUT4_O_15_I2": {
  179435. "hide_name": 0,
  179436. "bits": [ 964, 966, 2527, 2902 ],
  179437. "attributes": {
  179438. "force_downto": "00000000000000000000000000000001",
  179439. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179440. }
  179441. },
  179442. "cpu_I._zz_31__SB_LUT4_O_15_I2_SB_LUT4_O_I3": {
  179443. "hide_name": 0,
  179444. "bits": [ 1161, 1034, 2905 ],
  179445. "attributes": {
  179446. "force_downto": "00000000000000000000000000000001",
  179447. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179448. }
  179449. },
  179450. "cpu_I._zz_31__SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179451. "hide_name": 0,
  179452. "bits": [ 1078, 1037, 1043, 2906 ],
  179453. "attributes": {
  179454. "force_downto": "00000000000000000000000000000001",
  179455. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179456. }
  179457. },
  179458. "cpu_I._zz_31__SB_LUT4_O_15_I3": {
  179459. "hide_name": 0,
  179460. "bits": [ 2858, 2902, 2903 ],
  179461. "attributes": {
  179462. "force_downto": "00000000000000000000000000000001",
  179463. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179464. }
  179465. },
  179466. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2": {
  179467. "hide_name": 0,
  179468. "bits": [ 1246, 1247, 2907, 2908 ],
  179469. "attributes": {
  179470. "force_downto": "00000000000000000000000000000001",
  179471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179472. }
  179473. },
  179474. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179475. "hide_name": 0,
  179476. "bits": [ 2991, 2909 ],
  179477. "attributes": {
  179478. "force_downto": "00000000000000000000000000000001",
  179479. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179480. }
  179481. },
  179482. "cpu_I._zz_31__SB_LUT4_O_15_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179483. "hide_name": 0,
  179484. "bits": [ 2911, 2868, 2912 ],
  179485. "attributes": {
  179486. "force_downto": "00000000000000000000000000000001",
  179487. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179488. }
  179489. },
  179490. "cpu_I._zz_31__SB_LUT4_O_19_I2": {
  179491. "hide_name": 0,
  179492. "bits": [ 964, 966, 2398, 2923 ],
  179493. "attributes": {
  179494. "force_downto": "00000000000000000000000000000001",
  179495. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179496. }
  179497. },
  179498. "cpu_I._zz_31__SB_LUT4_O_19_I2_SB_LUT4_O_I3": {
  179499. "hide_name": 0,
  179500. "bits": [ 1157, 1034, 2926 ],
  179501. "attributes": {
  179502. "force_downto": "00000000000000000000000000000001",
  179503. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179504. }
  179505. },
  179506. "cpu_I._zz_31__SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179507. "hide_name": 0,
  179508. "bits": [ 1070, 1037, 1043, 2927 ],
  179509. "attributes": {
  179510. "force_downto": "00000000000000000000000000000001",
  179511. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179512. }
  179513. },
  179514. "cpu_I._zz_31__SB_LUT4_O_19_I3": {
  179515. "hide_name": 0,
  179516. "bits": [ 2858, 2923, 2924 ],
  179517. "attributes": {
  179518. "force_downto": "00000000000000000000000000000001",
  179519. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179520. }
  179521. },
  179522. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2": {
  179523. "hide_name": 0,
  179524. "bits": [ 1246, 1247, 2928, 2929 ],
  179525. "attributes": {
  179526. "force_downto": "00000000000000000000000000000001",
  179527. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179528. }
  179529. },
  179530. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179531. "hide_name": 0,
  179532. "bits": [ 966, 1250, 2398, 2930 ],
  179533. "attributes": {
  179534. "force_downto": "00000000000000000000000000000001",
  179535. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179536. }
  179537. },
  179538. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179539. "hide_name": 0,
  179540. "bits": [ 2474, 2362, 2931, 4818 ],
  179541. "attributes": {
  179542. "force_downto": "00000000000000000000000000000001",
  179543. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179544. }
  179545. },
  179546. "cpu_I._zz_31__SB_LUT4_O_19_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179547. "hide_name": 0,
  179548. "bits": [ 2932, 2868, 2933 ],
  179549. "attributes": {
  179550. "force_downto": "00000000000000000000000000000001",
  179551. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179552. }
  179553. },
  179554. "cpu_I._zz_31__SB_LUT4_O_22_I2": {
  179555. "hide_name": 0,
  179556. "bits": [ 964, 966, 2392, 2943 ],
  179557. "attributes": {
  179558. "force_downto": "00000000000000000000000000000001",
  179559. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179560. }
  179561. },
  179562. "cpu_I._zz_31__SB_LUT4_O_22_I2_SB_LUT4_O_I3": {
  179563. "hide_name": 0,
  179564. "bits": [ 1181, 1034, 2946 ],
  179565. "attributes": {
  179566. "force_downto": "00000000000000000000000000000001",
  179567. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179568. }
  179569. },
  179570. "cpu_I._zz_31__SB_LUT4_O_22_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179571. "hide_name": 0,
  179572. "bits": [ 1123, 1037, 1043, 2947 ],
  179573. "attributes": {
  179574. "force_downto": "00000000000000000000000000000001",
  179575. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179576. }
  179577. },
  179578. "cpu_I._zz_31__SB_LUT4_O_22_I3": {
  179579. "hide_name": 0,
  179580. "bits": [ 2858, 2943, 2944 ],
  179581. "attributes": {
  179582. "force_downto": "00000000000000000000000000000001",
  179583. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179584. }
  179585. },
  179586. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2": {
  179587. "hide_name": 0,
  179588. "bits": [ 1246, 1247, 2948, 2949 ],
  179589. "attributes": {
  179590. "force_downto": "00000000000000000000000000000001",
  179591. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179592. }
  179593. },
  179594. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179595. "hide_name": 0,
  179596. "bits": [ 2991, 2950 ],
  179597. "attributes": {
  179598. "force_downto": "00000000000000000000000000000001",
  179599. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179600. }
  179601. },
  179602. "cpu_I._zz_31__SB_LUT4_O_22_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179603. "hide_name": 0,
  179604. "bits": [ 2952, 2868, 2953 ],
  179605. "attributes": {
  179606. "force_downto": "00000000000000000000000000000001",
  179607. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179608. }
  179609. },
  179610. "cpu_I._zz_31__SB_LUT4_O_2_I3": {
  179611. "hide_name": 0,
  179612. "bits": [ 2858, 1129, 2935 ],
  179613. "attributes": {
  179614. "force_downto": "00000000000000000000000000000001",
  179615. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179616. }
  179617. },
  179618. "cpu_I._zz_31__SB_LUT4_O_2_I3_SB_LUT4_O_I2": {
  179619. "hide_name": 0,
  179620. "bits": [ 1246, 1247, 2972, 2973 ],
  179621. "attributes": {
  179622. "force_downto": "00000000000000000000000000000001",
  179623. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179624. }
  179625. },
  179626. "cpu_I._zz_31__SB_LUT4_O_31_I1": {
  179627. "hide_name": 0,
  179628. "bits": [ 964, 966, 2471, 2981 ],
  179629. "attributes": {
  179630. "force_downto": "00000000000000000000000000000001",
  179631. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179632. }
  179633. },
  179634. "cpu_I._zz_31__SB_LUT4_O_31_I1_SB_LUT4_O_I3": {
  179635. "hide_name": 0,
  179636. "bits": [ 1174, 1034, 2985 ],
  179637. "attributes": {
  179638. "force_downto": "00000000000000000000000000000001",
  179639. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179640. }
  179641. },
  179642. "cpu_I._zz_31__SB_LUT4_O_31_I1_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179643. "hide_name": 0,
  179644. "bits": [ 1109, 1037, 1043, 2986 ],
  179645. "attributes": {
  179646. "force_downto": "00000000000000000000000000000001",
  179647. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179648. }
  179649. },
  179650. "cpu_I._zz_31__SB_LUT4_O_31_I2": {
  179651. "hide_name": 0,
  179652. "bits": [ 2858, 2981, 2982, 2983 ],
  179653. "attributes": {
  179654. "force_downto": "00000000000000000000000000000001",
  179655. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179656. }
  179657. },
  179658. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I1": {
  179659. "hide_name": 0,
  179660. "bits": [ 1254, 1242, 2382, 4845 ],
  179661. "attributes": {
  179662. "force_downto": "00000000000000000000000000000001",
  179663. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179664. }
  179665. },
  179666. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I3": {
  179667. "hide_name": 0,
  179668. "bits": [ 1254, 1242, 2471, 2988 ],
  179669. "attributes": {
  179670. "force_downto": "00000000000000000000000000000001",
  179671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179672. }
  179673. },
  179674. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I2": {
  179675. "hide_name": 0,
  179676. "bits": [ "0", 2471, 2989, 2990 ],
  179677. "attributes": {
  179678. "force_downto": "00000000000000000000000000000001",
  179679. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179680. }
  179681. },
  179682. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  179683. "hide_name": 0,
  179684. "bits": [ 2990 ],
  179685. "attributes": {
  179686. "abc9_carry": "00000000000000000000000000000001",
  179687. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  179688. }
  179689. },
  179690. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3": {
  179691. "hide_name": 0,
  179692. "bits": [ 1246, 1247, 2987 ],
  179693. "attributes": {
  179694. "force_downto": "00000000000000000000000000000001",
  179695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179696. }
  179697. },
  179698. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179699. "hide_name": 0,
  179700. "bits": [ 2991, 2992 ],
  179701. "attributes": {
  179702. "force_downto": "00000000000000000000000000000001",
  179703. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179704. }
  179705. },
  179706. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179707. "hide_name": 0,
  179708. "bits": [ 2993, 4298, 4299, 4300 ],
  179709. "attributes": {
  179710. "force_downto": "00000000000000000000000000000001",
  179711. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179712. }
  179713. },
  179714. "cpu_I._zz_31__SB_LUT4_O_31_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179715. "hide_name": 0,
  179716. "bits": [ 2994, 2868, 2995 ],
  179717. "attributes": {
  179718. "force_downto": "00000000000000000000000000000001",
  179719. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179720. }
  179721. },
  179722. "cpu_I._zz_31__SB_LUT4_O_3_I2": {
  179723. "hide_name": 0,
  179724. "bits": [ 964, 966, 2380, 2974 ],
  179725. "attributes": {
  179726. "force_downto": "00000000000000000000000000000001",
  179727. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179728. }
  179729. },
  179730. "cpu_I._zz_31__SB_LUT4_O_3_I2_SB_LUT4_O_I3": {
  179731. "hide_name": 0,
  179732. "bits": [ 1172, 1034, 2997 ],
  179733. "attributes": {
  179734. "force_downto": "00000000000000000000000000000001",
  179735. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179736. }
  179737. },
  179738. "cpu_I._zz_31__SB_LUT4_O_3_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179739. "hide_name": 0,
  179740. "bits": [ 1104, 1037, 1043, 2998 ],
  179741. "attributes": {
  179742. "force_downto": "00000000000000000000000000000001",
  179743. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179744. }
  179745. },
  179746. "cpu_I._zz_31__SB_LUT4_O_3_I3": {
  179747. "hide_name": 0,
  179748. "bits": [ 2858, 2974, 2975 ],
  179749. "attributes": {
  179750. "force_downto": "00000000000000000000000000000001",
  179751. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179752. }
  179753. },
  179754. "cpu_I._zz_31__SB_LUT4_O_3_I3_SB_LUT4_O_I2": {
  179755. "hide_name": 0,
  179756. "bits": [ 1246, 1247, 2999, 3000 ],
  179757. "attributes": {
  179758. "force_downto": "00000000000000000000000000000001",
  179759. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179760. }
  179761. },
  179762. "cpu_I._zz_31__SB_LUT4_O_4_I2": {
  179763. "hide_name": 0,
  179764. "bits": [ 964, 966, 2383, 3001 ],
  179765. "attributes": {
  179766. "force_downto": "00000000000000000000000000000001",
  179767. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179768. }
  179769. },
  179770. "cpu_I._zz_31__SB_LUT4_O_4_I2_SB_LUT4_O_I3": {
  179771. "hide_name": 0,
  179772. "bits": [ 1171, 1034, 3004 ],
  179773. "attributes": {
  179774. "force_downto": "00000000000000000000000000000001",
  179775. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179776. }
  179777. },
  179778. "cpu_I._zz_31__SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179779. "hide_name": 0,
  179780. "bits": [ 1102, 1037, 1043, 3005 ],
  179781. "attributes": {
  179782. "force_downto": "00000000000000000000000000000001",
  179783. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179784. }
  179785. },
  179786. "cpu_I._zz_31__SB_LUT4_O_4_I3": {
  179787. "hide_name": 0,
  179788. "bits": [ 2858, 3001, 3002 ],
  179789. "attributes": {
  179790. "force_downto": "00000000000000000000000000000001",
  179791. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179792. }
  179793. },
  179794. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2": {
  179795. "hide_name": 0,
  179796. "bits": [ 1246, 1247, 3006, 3007 ],
  179797. "attributes": {
  179798. "force_downto": "00000000000000000000000000000001",
  179799. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179800. }
  179801. },
  179802. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179803. "hide_name": 0,
  179804. "bits": [ 966, 1250, 2383, 3008 ],
  179805. "attributes": {
  179806. "force_downto": "00000000000000000000000000000001",
  179807. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179808. }
  179809. },
  179810. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179811. "hide_name": 0,
  179812. "bits": [ 2951, 3032, 3009, 3013 ],
  179813. "attributes": {
  179814. "force_downto": "00000000000000000000000000000001",
  179815. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179816. }
  179817. },
  179818. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  179819. "hide_name": 0,
  179820. "bits": [ 4264, 2868, 3017 ],
  179821. "attributes": {
  179822. "force_downto": "00000000000000000000000000000001",
  179823. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179824. }
  179825. },
  179826. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179827. "hide_name": 0,
  179828. "bits": [ 3014, 2991, 2868, 3015 ],
  179829. "attributes": {
  179830. "force_downto": "00000000000000000000000000000001",
  179831. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179832. }
  179833. },
  179834. "cpu_I._zz_31__SB_LUT4_O_4_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179835. "hide_name": 0,
  179836. "bits": [ 1254, 2383, 3018, 3020 ],
  179837. "attributes": {
  179838. "force_downto": "00000000000000000000000000000001",
  179839. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179840. }
  179841. },
  179842. "cpu_I._zz_31__SB_LUT4_O_5_I2": {
  179843. "hide_name": 0,
  179844. "bits": [ 964, 966, 2385, 3023 ],
  179845. "attributes": {
  179846. "force_downto": "00000000000000000000000000000001",
  179847. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179848. }
  179849. },
  179850. "cpu_I._zz_31__SB_LUT4_O_5_I2_SB_LUT4_O_I3": {
  179851. "hide_name": 0,
  179852. "bits": [ 1170, 1034, 3026 ],
  179853. "attributes": {
  179854. "force_downto": "00000000000000000000000000000001",
  179855. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179856. }
  179857. },
  179858. "cpu_I._zz_31__SB_LUT4_O_5_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179859. "hide_name": 0,
  179860. "bits": [ 1100, 1037, 1043, 3027 ],
  179861. "attributes": {
  179862. "force_downto": "00000000000000000000000000000001",
  179863. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179864. }
  179865. },
  179866. "cpu_I._zz_31__SB_LUT4_O_5_I3": {
  179867. "hide_name": 0,
  179868. "bits": [ 2858, 3023, 3024 ],
  179869. "attributes": {
  179870. "force_downto": "00000000000000000000000000000001",
  179871. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179872. }
  179873. },
  179874. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2": {
  179875. "hide_name": 0,
  179876. "bits": [ 1246, 1247, 3028, 3029 ],
  179877. "attributes": {
  179878. "force_downto": "00000000000000000000000000000001",
  179879. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179880. }
  179881. },
  179882. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179883. "hide_name": 0,
  179884. "bits": [ 2991, 3030 ],
  179885. "attributes": {
  179886. "force_downto": "00000000000000000000000000000001",
  179887. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179888. }
  179889. },
  179890. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179891. "hide_name": 0,
  179892. "bits": [ 1254, 2385, 3031, 3033 ],
  179893. "attributes": {
  179894. "force_downto": "00000000000000000000000000000001",
  179895. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179896. }
  179897. },
  179898. "cpu_I._zz_31__SB_LUT4_O_5_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179899. "hide_name": 0,
  179900. "bits": [ 3034, 2871, 2872, 3035 ],
  179901. "attributes": {
  179902. "force_downto": "00000000000000000000000000000001",
  179903. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179904. }
  179905. },
  179906. "cpu_I._zz_31__SB_LUT4_O_6_I3": {
  179907. "hide_name": 0,
  179908. "bits": [ 2858, 2844, 3037 ],
  179909. "attributes": {
  179910. "force_downto": "00000000000000000000000000000001",
  179911. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179912. }
  179913. },
  179914. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2": {
  179915. "hide_name": 0,
  179916. "bits": [ 1246, 1247, 3039, 3040 ],
  179917. "attributes": {
  179918. "force_downto": "00000000000000000000000000000001",
  179919. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179920. }
  179921. },
  179922. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179923. "hide_name": 0,
  179924. "bits": [ 2991, 3041 ],
  179925. "attributes": {
  179926. "force_downto": "00000000000000000000000000000001",
  179927. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179928. }
  179929. },
  179930. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I2_O": {
  179931. "hide_name": 0,
  179932. "bits": [ 2386, 4857, 4840, 3042 ],
  179933. "attributes": {
  179934. "force_downto": "00000000000000000000000000000001",
  179935. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179936. }
  179937. },
  179938. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  179939. "hide_name": 0,
  179940. "bits": [ 1254, 2387, 3043, 3044 ],
  179941. "attributes": {
  179942. "force_downto": "00000000000000000000000000000001",
  179943. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179944. }
  179945. },
  179946. "cpu_I._zz_31__SB_LUT4_O_6_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179947. "hide_name": 0,
  179948. "bits": [ 3045, 2868, 3046 ],
  179949. "attributes": {
  179950. "force_downto": "00000000000000000000000000000001",
  179951. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179952. }
  179953. },
  179954. "cpu_I._zz_31__SB_LUT4_O_7_I2": {
  179955. "hide_name": 0,
  179956. "bits": [ 964, 966, 2393, 3048 ],
  179957. "attributes": {
  179958. "force_downto": "00000000000000000000000000000001",
  179959. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179960. }
  179961. },
  179962. "cpu_I._zz_31__SB_LUT4_O_7_I2_SB_LUT4_O_I3": {
  179963. "hide_name": 0,
  179964. "bits": [ 1169, 1034, 3051 ],
  179965. "attributes": {
  179966. "force_downto": "00000000000000000000000000000001",
  179967. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179968. }
  179969. },
  179970. "cpu_I._zz_31__SB_LUT4_O_7_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  179971. "hide_name": 0,
  179972. "bits": [ 1096, 1037, 1043, 3052 ],
  179973. "attributes": {
  179974. "force_downto": "00000000000000000000000000000001",
  179975. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179976. }
  179977. },
  179978. "cpu_I._zz_31__SB_LUT4_O_7_I3": {
  179979. "hide_name": 0,
  179980. "bits": [ 2858, 3048, 3049 ],
  179981. "attributes": {
  179982. "force_downto": "00000000000000000000000000000001",
  179983. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179984. }
  179985. },
  179986. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2": {
  179987. "hide_name": 0,
  179988. "bits": [ 1246, 1247, 3053, 3054 ],
  179989. "attributes": {
  179990. "force_downto": "00000000000000000000000000000001",
  179991. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  179992. }
  179993. },
  179994. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  179995. "hide_name": 0,
  179996. "bits": [ 2991, 3055 ],
  179997. "attributes": {
  179998. "force_downto": "00000000000000000000000000000001",
  179999. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180000. }
  180001. },
  180002. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I2_O": {
  180003. "hide_name": 0,
  180004. "bits": [ 2470, 2367, 4281, 3056 ],
  180005. "attributes": {
  180006. "force_downto": "00000000000000000000000000000001",
  180007. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180008. }
  180009. },
  180010. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  180011. "hide_name": 0,
  180012. "bits": [ 1254, 2393, 3057, 3058 ],
  180013. "attributes": {
  180014. "force_downto": "00000000000000000000000000000001",
  180015. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180016. }
  180017. },
  180018. "cpu_I._zz_31__SB_LUT4_O_7_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  180019. "hide_name": 0,
  180020. "bits": [ 3059, 2868, 3060 ],
  180021. "attributes": {
  180022. "force_downto": "00000000000000000000000000000001",
  180023. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180024. }
  180025. },
  180026. "cpu_I._zz_31__SB_LUT4_O_9_I2": {
  180027. "hide_name": 0,
  180028. "bits": [ 964, 966, 2397, 3065 ],
  180029. "attributes": {
  180030. "force_downto": "00000000000000000000000000000001",
  180031. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180032. }
  180033. },
  180034. "cpu_I._zz_31__SB_LUT4_O_9_I2_SB_LUT4_O_I3": {
  180035. "hide_name": 0,
  180036. "bits": [ 1167, 1034, 3068 ],
  180037. "attributes": {
  180038. "force_downto": "00000000000000000000000000000001",
  180039. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180040. }
  180041. },
  180042. "cpu_I._zz_31__SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  180043. "hide_name": 0,
  180044. "bits": [ 1092, 1037, 1043, 3069 ],
  180045. "attributes": {
  180046. "force_downto": "00000000000000000000000000000001",
  180047. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180048. }
  180049. },
  180050. "cpu_I._zz_31__SB_LUT4_O_9_I3": {
  180051. "hide_name": 0,
  180052. "bits": [ 2858, 3065, 3066 ],
  180053. "attributes": {
  180054. "force_downto": "00000000000000000000000000000001",
  180055. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180056. }
  180057. },
  180058. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2": {
  180059. "hide_name": 0,
  180060. "bits": [ 1246, 1247, 3070, 3071 ],
  180061. "attributes": {
  180062. "force_downto": "00000000000000000000000000000001",
  180063. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180064. }
  180065. },
  180066. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  180067. "hide_name": 0,
  180068. "bits": [ 2991, 3072 ],
  180069. "attributes": {
  180070. "force_downto": "00000000000000000000000000000001",
  180071. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180072. }
  180073. },
  180074. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  180075. "hide_name": 0,
  180076. "bits": [ 3010, 3011, 2910, 3012 ],
  180077. "attributes": {
  180078. "force_downto": "00000000000000000000000000000001",
  180079. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180080. }
  180081. },
  180082. "cpu_I._zz_31__SB_LUT4_O_9_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  180083. "hide_name": 0,
  180084. "bits": [ 3074, 2868, 3075 ],
  180085. "attributes": {
  180086. "force_downto": "00000000000000000000000000000001",
  180087. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180088. }
  180089. },
  180090. "cpu_I._zz_31__SB_LUT4_O_I2": {
  180091. "hide_name": 0,
  180092. "bits": [ 964, 966, 2470, 2769 ],
  180093. "attributes": {
  180094. "force_downto": "00000000000000000000000000000001",
  180095. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180096. }
  180097. },
  180098. "cpu_I._zz_31__SB_LUT4_O_I3": {
  180099. "hide_name": 0,
  180100. "bits": [ 2858, 2769, 2859 ],
  180101. "attributes": {
  180102. "force_downto": "00000000000000000000000000000001",
  180103. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180104. }
  180105. },
  180106. "cpu_I._zz_31__SB_LUT4_O_I3_SB_LUT4_O_I2": {
  180107. "hide_name": 0,
  180108. "bits": [ 1246, 1247, 3077, 3078 ],
  180109. "attributes": {
  180110. "force_downto": "00000000000000000000000000000001",
  180111. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180112. }
  180113. },
  180114. "cpu_I._zz_321_": {
  180115. "hide_name": 0,
  180116. "bits": [ "0", "0", 2328, "0", 1543, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180117. "attributes": {
  180118. "hdlname": "cpu_I _zz_321_",
  180119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:548.23-548.31"
  180120. }
  180121. },
  180122. "cpu_I._zz_322_": {
  180123. "hide_name": 0,
  180124. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180125. "attributes": {
  180126. "hdlname": "cpu_I _zz_322_",
  180127. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:549.23-549.31"
  180128. }
  180129. },
  180130. "cpu_I._zz_324_": {
  180131. "hide_name": 0,
  180132. "bits": [ 2588 ],
  180133. "attributes": {
  180134. "hdlname": "cpu_I _zz_324_",
  180135. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:551.23-551.31"
  180136. }
  180137. },
  180138. "cpu_I._zz_326_": {
  180139. "hide_name": 0,
  180140. "bits": [ "0", "0", "0" ],
  180141. "attributes": {
  180142. "hdlname": "cpu_I _zz_326_",
  180143. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:553.23-553.31"
  180144. }
  180145. },
  180146. "cpu_I._zz_327_": {
  180147. "hide_name": 0,
  180148. "bits": [ 2340 ],
  180149. "attributes": {
  180150. "hdlname": "cpu_I _zz_327_",
  180151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:554.23-554.31"
  180152. }
  180153. },
  180154. "cpu_I._zz_329_": {
  180155. "hide_name": 0,
  180156. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7084, 3287, 3286, 2337, 7085, 2333, 2327, 2341, 7086 ],
  180157. "attributes": {
  180158. "hdlname": "cpu_I _zz_329_",
  180159. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:556.23-556.31",
  180160. "unused_bits": "10 14 18"
  180161. }
  180162. },
  180163. "cpu_I._zz_32_": {
  180164. "hide_name": 0,
  180165. "bits": [ 3179, 3234, 3196, 3082, 3085, 3164, 3231, 3246, 3184, 3251, 3239, 3256, 3261, 3266, 3271, 3088, 3099, 3104, 3111, 3118, 3125, 3222, 3132, 3215, 3139, 3146, 3153, 3167, 3208, 3203, 3189, 3172 ],
  180166. "attributes": {
  180167. "hdlname": "cpu_I _zz_32_",
  180168. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:777.23-777.30"
  180169. }
  180170. },
  180171. "cpu_I._zz_32__SB_LUT4_O_10_I3": {
  180172. "hide_name": 0,
  180173. "bits": [ 3086, 3080, 3087 ],
  180174. "attributes": {
  180175. "force_downto": "00000000000000000000000000000001",
  180176. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180177. }
  180178. },
  180179. "cpu_I._zz_32__SB_LUT4_O_10_I3_SB_LUT4_O_I2": {
  180180. "hide_name": 0,
  180181. "bits": [ 3089, 3090, 3091, 3092 ],
  180182. "attributes": {
  180183. "force_downto": "00000000000000000000000000000001",
  180184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180185. }
  180186. },
  180187. "cpu_I._zz_32__SB_LUT4_O_11_I3": {
  180188. "hide_name": 0,
  180189. "bits": [ 3097, 3080, 3098 ],
  180190. "attributes": {
  180191. "force_downto": "00000000000000000000000000000001",
  180192. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180193. }
  180194. },
  180195. "cpu_I._zz_32__SB_LUT4_O_11_I3_SB_LUT4_O_I2": {
  180196. "hide_name": 0,
  180197. "bits": [ 3100, 3090, 3101, 3092 ],
  180198. "attributes": {
  180199. "force_downto": "00000000000000000000000000000001",
  180200. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180201. }
  180202. },
  180203. "cpu_I._zz_32__SB_LUT4_O_12_I3": {
  180204. "hide_name": 0,
  180205. "bits": [ 3102, 3080, 3103 ],
  180206. "attributes": {
  180207. "force_downto": "00000000000000000000000000000001",
  180208. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180209. }
  180210. },
  180211. "cpu_I._zz_32__SB_LUT4_O_12_I3_SB_LUT4_O_I2": {
  180212. "hide_name": 0,
  180213. "bits": [ 3105, 3090, 3106, 3092 ],
  180214. "attributes": {
  180215. "force_downto": "00000000000000000000000000000001",
  180216. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180217. }
  180218. },
  180219. "cpu_I._zz_32__SB_LUT4_O_13_I3": {
  180220. "hide_name": 0,
  180221. "bits": [ 3109, 3080, 3110 ],
  180222. "attributes": {
  180223. "force_downto": "00000000000000000000000000000001",
  180224. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180225. }
  180226. },
  180227. "cpu_I._zz_32__SB_LUT4_O_13_I3_SB_LUT4_O_I2": {
  180228. "hide_name": 0,
  180229. "bits": [ 3112, 3090, 3113, 3092 ],
  180230. "attributes": {
  180231. "force_downto": "00000000000000000000000000000001",
  180232. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180233. }
  180234. },
  180235. "cpu_I._zz_32__SB_LUT4_O_14_I3": {
  180236. "hide_name": 0,
  180237. "bits": [ 3116, 3080, 3117 ],
  180238. "attributes": {
  180239. "force_downto": "00000000000000000000000000000001",
  180240. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180241. }
  180242. },
  180243. "cpu_I._zz_32__SB_LUT4_O_14_I3_SB_LUT4_O_I2": {
  180244. "hide_name": 0,
  180245. "bits": [ 3119, 3090, 3120, 3092 ],
  180246. "attributes": {
  180247. "force_downto": "00000000000000000000000000000001",
  180248. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180249. }
  180250. },
  180251. "cpu_I._zz_32__SB_LUT4_O_15_I3": {
  180252. "hide_name": 0,
  180253. "bits": [ 3123, 3080, 3124 ],
  180254. "attributes": {
  180255. "force_downto": "00000000000000000000000000000001",
  180256. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180257. }
  180258. },
  180259. "cpu_I._zz_32__SB_LUT4_O_15_I3_SB_LUT4_O_I2": {
  180260. "hide_name": 0,
  180261. "bits": [ 3126, 3090, 3127, 3092 ],
  180262. "attributes": {
  180263. "force_downto": "00000000000000000000000000000001",
  180264. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180265. }
  180266. },
  180267. "cpu_I._zz_32__SB_LUT4_O_16_I3": {
  180268. "hide_name": 0,
  180269. "bits": [ 3130, 3080, 3131 ],
  180270. "attributes": {
  180271. "force_downto": "00000000000000000000000000000001",
  180272. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180273. }
  180274. },
  180275. "cpu_I._zz_32__SB_LUT4_O_16_I3_SB_LUT4_O_I2": {
  180276. "hide_name": 0,
  180277. "bits": [ 3133, 3090, 3134, 3092 ],
  180278. "attributes": {
  180279. "force_downto": "00000000000000000000000000000001",
  180280. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180281. }
  180282. },
  180283. "cpu_I._zz_32__SB_LUT4_O_17_I3": {
  180284. "hide_name": 0,
  180285. "bits": [ 3137, 3080, 3138 ],
  180286. "attributes": {
  180287. "force_downto": "00000000000000000000000000000001",
  180288. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180289. }
  180290. },
  180291. "cpu_I._zz_32__SB_LUT4_O_17_I3_SB_LUT4_O_I2": {
  180292. "hide_name": 0,
  180293. "bits": [ 3140, 3090, 3141, 3092 ],
  180294. "attributes": {
  180295. "force_downto": "00000000000000000000000000000001",
  180296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180297. }
  180298. },
  180299. "cpu_I._zz_32__SB_LUT4_O_18_I3": {
  180300. "hide_name": 0,
  180301. "bits": [ 3144, 3080, 3145 ],
  180302. "attributes": {
  180303. "force_downto": "00000000000000000000000000000001",
  180304. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180305. }
  180306. },
  180307. "cpu_I._zz_32__SB_LUT4_O_18_I3_SB_LUT4_O_I2": {
  180308. "hide_name": 0,
  180309. "bits": [ 3147, 3090, 3148, 3092 ],
  180310. "attributes": {
  180311. "force_downto": "00000000000000000000000000000001",
  180312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180313. }
  180314. },
  180315. "cpu_I._zz_32__SB_LUT4_O_19_I3": {
  180316. "hide_name": 0,
  180317. "bits": [ 3151, 3080, 3152 ],
  180318. "attributes": {
  180319. "force_downto": "00000000000000000000000000000001",
  180320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180321. }
  180322. },
  180323. "cpu_I._zz_32__SB_LUT4_O_19_I3_SB_LUT4_O_I2": {
  180324. "hide_name": 0,
  180325. "bits": [ 3154, 3090, 3155, 3092 ],
  180326. "attributes": {
  180327. "force_downto": "00000000000000000000000000000001",
  180328. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180329. }
  180330. },
  180331. "cpu_I._zz_32__SB_LUT4_O_1_I3": {
  180332. "hide_name": 0,
  180333. "bits": [ 3083, 3080, 3084 ],
  180334. "attributes": {
  180335. "force_downto": "00000000000000000000000000000001",
  180336. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180337. }
  180338. },
  180339. "cpu_I._zz_32__SB_LUT4_O_1_I3_SB_LUT4_O_I2": {
  180340. "hide_name": 0,
  180341. "bits": [ 3158, 3090, 3159, 3092 ],
  180342. "attributes": {
  180343. "force_downto": "00000000000000000000000000000001",
  180344. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180345. }
  180346. },
  180347. "cpu_I._zz_32__SB_LUT4_O_20_I3": {
  180348. "hide_name": 0,
  180349. "bits": [ 3165, 3080, 3166 ],
  180350. "attributes": {
  180351. "force_downto": "00000000000000000000000000000001",
  180352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180353. }
  180354. },
  180355. "cpu_I._zz_32__SB_LUT4_O_20_I3_SB_LUT4_O_I2": {
  180356. "hide_name": 0,
  180357. "bits": [ 3168, 3090, 3169, 3092 ],
  180358. "attributes": {
  180359. "force_downto": "00000000000000000000000000000001",
  180360. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180361. }
  180362. },
  180363. "cpu_I._zz_32__SB_LUT4_O_21_I3": {
  180364. "hide_name": 0,
  180365. "bits": [ 3170, 3080, 3171 ],
  180366. "attributes": {
  180367. "force_downto": "00000000000000000000000000000001",
  180368. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180369. }
  180370. },
  180371. "cpu_I._zz_32__SB_LUT4_O_21_I3_SB_LUT4_O_I2": {
  180372. "hide_name": 0,
  180373. "bits": [ 3173, 3090, 3174, 3092 ],
  180374. "attributes": {
  180375. "force_downto": "00000000000000000000000000000001",
  180376. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180377. }
  180378. },
  180379. "cpu_I._zz_32__SB_LUT4_O_22_I3": {
  180380. "hide_name": 0,
  180381. "bits": [ 3177, 3080, 3178 ],
  180382. "attributes": {
  180383. "force_downto": "00000000000000000000000000000001",
  180384. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180385. }
  180386. },
  180387. "cpu_I._zz_32__SB_LUT4_O_22_I3_SB_LUT4_O_I2": {
  180388. "hide_name": 0,
  180389. "bits": [ 3180, 3090, 3181, 3092 ],
  180390. "attributes": {
  180391. "force_downto": "00000000000000000000000000000001",
  180392. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180393. }
  180394. },
  180395. "cpu_I._zz_32__SB_LUT4_O_23_I3": {
  180396. "hide_name": 0,
  180397. "bits": [ 3182, 3080, 3183 ],
  180398. "attributes": {
  180399. "force_downto": "00000000000000000000000000000001",
  180400. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180401. }
  180402. },
  180403. "cpu_I._zz_32__SB_LUT4_O_24_I3": {
  180404. "hide_name": 0,
  180405. "bits": [ 3187, 3080, 3188 ],
  180406. "attributes": {
  180407. "force_downto": "00000000000000000000000000000001",
  180408. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180409. }
  180410. },
  180411. "cpu_I._zz_32__SB_LUT4_O_24_I3_SB_LUT4_O_I2": {
  180412. "hide_name": 0,
  180413. "bits": [ 3190, 3090, 3191, 3092 ],
  180414. "attributes": {
  180415. "force_downto": "00000000000000000000000000000001",
  180416. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180417. }
  180418. },
  180419. "cpu_I._zz_32__SB_LUT4_O_25_I3": {
  180420. "hide_name": 0,
  180421. "bits": [ 3194, 3080, 3195 ],
  180422. "attributes": {
  180423. "force_downto": "00000000000000000000000000000001",
  180424. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180425. }
  180426. },
  180427. "cpu_I._zz_32__SB_LUT4_O_25_I3_SB_LUT4_O_I2": {
  180428. "hide_name": 0,
  180429. "bits": [ 3197, 3090, 3198, 3092 ],
  180430. "attributes": {
  180431. "force_downto": "00000000000000000000000000000001",
  180432. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180433. }
  180434. },
  180435. "cpu_I._zz_32__SB_LUT4_O_26_I3": {
  180436. "hide_name": 0,
  180437. "bits": [ 3201, 3080, 3202 ],
  180438. "attributes": {
  180439. "force_downto": "00000000000000000000000000000001",
  180440. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180441. }
  180442. },
  180443. "cpu_I._zz_32__SB_LUT4_O_26_I3_SB_LUT4_O_I2": {
  180444. "hide_name": 0,
  180445. "bits": [ 3204, 3090, 3205, 3092 ],
  180446. "attributes": {
  180447. "force_downto": "00000000000000000000000000000001",
  180448. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180449. }
  180450. },
  180451. "cpu_I._zz_32__SB_LUT4_O_27_I3": {
  180452. "hide_name": 0,
  180453. "bits": [ 3206, 3080, 3207 ],
  180454. "attributes": {
  180455. "force_downto": "00000000000000000000000000000001",
  180456. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180457. }
  180458. },
  180459. "cpu_I._zz_32__SB_LUT4_O_27_I3_SB_LUT4_O_I2": {
  180460. "hide_name": 0,
  180461. "bits": [ 3209, 3090, 3210, 3092 ],
  180462. "attributes": {
  180463. "force_downto": "00000000000000000000000000000001",
  180464. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180465. }
  180466. },
  180467. "cpu_I._zz_32__SB_LUT4_O_28_I3": {
  180468. "hide_name": 0,
  180469. "bits": [ 3213, 3080, 3214 ],
  180470. "attributes": {
  180471. "force_downto": "00000000000000000000000000000001",
  180472. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180473. }
  180474. },
  180475. "cpu_I._zz_32__SB_LUT4_O_28_I3_SB_LUT4_O_I2": {
  180476. "hide_name": 0,
  180477. "bits": [ 3216, 3090, 3217, 3092 ],
  180478. "attributes": {
  180479. "force_downto": "00000000000000000000000000000001",
  180480. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180481. }
  180482. },
  180483. "cpu_I._zz_32__SB_LUT4_O_29_I3": {
  180484. "hide_name": 0,
  180485. "bits": [ 3220, 3080, 3221 ],
  180486. "attributes": {
  180487. "force_downto": "00000000000000000000000000000001",
  180488. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180489. }
  180490. },
  180491. "cpu_I._zz_32__SB_LUT4_O_29_I3_SB_LUT4_O_I2": {
  180492. "hide_name": 0,
  180493. "bits": [ 3223, 3090, 3224, 3092 ],
  180494. "attributes": {
  180495. "force_downto": "00000000000000000000000000000001",
  180496. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180497. }
  180498. },
  180499. "cpu_I._zz_32__SB_LUT4_O_2_I3": {
  180500. "hide_name": 0,
  180501. "bits": [ 3162, 3080, 3163 ],
  180502. "attributes": {
  180503. "force_downto": "00000000000000000000000000000001",
  180504. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180505. }
  180506. },
  180507. "cpu_I._zz_32__SB_LUT4_O_2_I3_SB_LUT4_O_I2": {
  180508. "hide_name": 0,
  180509. "bits": [ 3227, 3090, 3228, 3092 ],
  180510. "attributes": {
  180511. "force_downto": "00000000000000000000000000000001",
  180512. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180513. }
  180514. },
  180515. "cpu_I._zz_32__SB_LUT4_O_30_I3": {
  180516. "hide_name": 0,
  180517. "bits": [ 3232, 3080, 3233 ],
  180518. "attributes": {
  180519. "force_downto": "00000000000000000000000000000001",
  180520. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180521. }
  180522. },
  180523. "cpu_I._zz_32__SB_LUT4_O_30_I3_SB_LUT4_O_I2": {
  180524. "hide_name": 0,
  180525. "bits": [ 3235, 3090, 3236, 3092 ],
  180526. "attributes": {
  180527. "force_downto": "00000000000000000000000000000001",
  180528. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180529. }
  180530. },
  180531. "cpu_I._zz_32__SB_LUT4_O_31_I3": {
  180532. "hide_name": 0,
  180533. "bits": [ 3237, 3080, 3238 ],
  180534. "attributes": {
  180535. "force_downto": "00000000000000000000000000000001",
  180536. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180537. }
  180538. },
  180539. "cpu_I._zz_32__SB_LUT4_O_31_I3_SB_LUT4_O_I2": {
  180540. "hide_name": 0,
  180541. "bits": [ 3240, 3090, 3241, 3092 ],
  180542. "attributes": {
  180543. "force_downto": "00000000000000000000000000000001",
  180544. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180545. }
  180546. },
  180547. "cpu_I._zz_32__SB_LUT4_O_3_I3": {
  180548. "hide_name": 0,
  180549. "bits": [ 3229, 3080, 3230 ],
  180550. "attributes": {
  180551. "force_downto": "00000000000000000000000000000001",
  180552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180553. }
  180554. },
  180555. "cpu_I._zz_32__SB_LUT4_O_3_I3_SB_LUT4_O_I2": {
  180556. "hide_name": 0,
  180557. "bits": [ 3242, 3090, 3243, 3092 ],
  180558. "attributes": {
  180559. "force_downto": "00000000000000000000000000000001",
  180560. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180561. }
  180562. },
  180563. "cpu_I._zz_32__SB_LUT4_O_4_I3": {
  180564. "hide_name": 0,
  180565. "bits": [ 3244, 3080, 3245 ],
  180566. "attributes": {
  180567. "force_downto": "00000000000000000000000000000001",
  180568. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180569. }
  180570. },
  180571. "cpu_I._zz_32__SB_LUT4_O_4_I3_SB_LUT4_O_I2": {
  180572. "hide_name": 0,
  180573. "bits": [ 3247, 3090, 3248, 3092 ],
  180574. "attributes": {
  180575. "force_downto": "00000000000000000000000000000001",
  180576. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180577. }
  180578. },
  180579. "cpu_I._zz_32__SB_LUT4_O_5_I3": {
  180580. "hide_name": 0,
  180581. "bits": [ 3249, 3080, 3250 ],
  180582. "attributes": {
  180583. "force_downto": "00000000000000000000000000000001",
  180584. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180585. }
  180586. },
  180587. "cpu_I._zz_32__SB_LUT4_O_5_I3_SB_LUT4_O_I2": {
  180588. "hide_name": 0,
  180589. "bits": [ 3252, 3090, 3253, 3092 ],
  180590. "attributes": {
  180591. "force_downto": "00000000000000000000000000000001",
  180592. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180593. }
  180594. },
  180595. "cpu_I._zz_32__SB_LUT4_O_6_I3": {
  180596. "hide_name": 0,
  180597. "bits": [ 3254, 3080, 3255 ],
  180598. "attributes": {
  180599. "force_downto": "00000000000000000000000000000001",
  180600. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180601. }
  180602. },
  180603. "cpu_I._zz_32__SB_LUT4_O_6_I3_SB_LUT4_O_I2": {
  180604. "hide_name": 0,
  180605. "bits": [ 3257, 3090, 3258, 3092 ],
  180606. "attributes": {
  180607. "force_downto": "00000000000000000000000000000001",
  180608. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180609. }
  180610. },
  180611. "cpu_I._zz_32__SB_LUT4_O_7_I3": {
  180612. "hide_name": 0,
  180613. "bits": [ 3259, 3080, 3260 ],
  180614. "attributes": {
  180615. "force_downto": "00000000000000000000000000000001",
  180616. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180617. }
  180618. },
  180619. "cpu_I._zz_32__SB_LUT4_O_7_I3_SB_LUT4_O_I2": {
  180620. "hide_name": 0,
  180621. "bits": [ 3262, 3090, 3263, 3092 ],
  180622. "attributes": {
  180623. "force_downto": "00000000000000000000000000000001",
  180624. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180625. }
  180626. },
  180627. "cpu_I._zz_32__SB_LUT4_O_8_I3": {
  180628. "hide_name": 0,
  180629. "bits": [ 3264, 3080, 3265 ],
  180630. "attributes": {
  180631. "force_downto": "00000000000000000000000000000001",
  180632. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180633. }
  180634. },
  180635. "cpu_I._zz_32__SB_LUT4_O_8_I3_SB_LUT4_O_I2": {
  180636. "hide_name": 0,
  180637. "bits": [ 3267, 3090, 3268, 3092 ],
  180638. "attributes": {
  180639. "force_downto": "00000000000000000000000000000001",
  180640. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180641. }
  180642. },
  180643. "cpu_I._zz_32__SB_LUT4_O_9_I3": {
  180644. "hide_name": 0,
  180645. "bits": [ 3269, 3080, 3270 ],
  180646. "attributes": {
  180647. "force_downto": "00000000000000000000000000000001",
  180648. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180649. }
  180650. },
  180651. "cpu_I._zz_32__SB_LUT4_O_9_I3_SB_LUT4_O_I2": {
  180652. "hide_name": 0,
  180653. "bits": [ 3272, 3090, 3273, 3092 ],
  180654. "attributes": {
  180655. "force_downto": "00000000000000000000000000000001",
  180656. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180657. }
  180658. },
  180659. "cpu_I._zz_32__SB_LUT4_O_I3": {
  180660. "hide_name": 0,
  180661. "bits": [ 3079, 3080, 3081 ],
  180662. "attributes": {
  180663. "force_downto": "00000000000000000000000000000001",
  180664. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180665. }
  180666. },
  180667. "cpu_I._zz_32__SB_LUT4_O_I3_SB_LUT4_O_I2": {
  180668. "hide_name": 0,
  180669. "bits": [ 3274, 3090, 3275, 3092 ],
  180670. "attributes": {
  180671. "force_downto": "00000000000000000000000000000001",
  180672. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180673. }
  180674. },
  180675. "cpu_I._zz_32__SB_LUT4_O_I3_SB_LUT4_O_I3": {
  180676. "hide_name": 0,
  180677. "bits": [ 3185, 3090, 3186, 3092 ],
  180678. "attributes": {
  180679. "force_downto": "00000000000000000000000000000001",
  180680. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180681. }
  180682. },
  180683. "cpu_I._zz_330_": {
  180684. "hide_name": 0,
  180685. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180686. "attributes": {
  180687. "hdlname": "cpu_I _zz_330_",
  180688. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:557.23-557.31"
  180689. }
  180690. },
  180691. "cpu_I._zz_331_": {
  180692. "hide_name": 0,
  180693. "bits": [ "0", "0", "0", "0", 1543, "0", 1363, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180694. "attributes": {
  180695. "hdlname": "cpu_I _zz_331_",
  180696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:558.23-558.31"
  180697. }
  180698. },
  180699. "cpu_I._zz_332_": {
  180700. "hide_name": 0,
  180701. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180702. "attributes": {
  180703. "hdlname": "cpu_I _zz_332_",
  180704. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:559.23-559.31"
  180705. }
  180706. },
  180707. "cpu_I._zz_335_": {
  180708. "hide_name": 0,
  180709. "bits": [ "0", "0", "1", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180710. "attributes": {
  180711. "hdlname": "cpu_I _zz_335_",
  180712. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:562.23-562.31"
  180713. }
  180714. },
  180715. "cpu_I._zz_336_": {
  180716. "hide_name": 0,
  180717. "bits": [ "0", "0", "1", "0", "1", "1", "1", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0" ],
  180718. "attributes": {
  180719. "hdlname": "cpu_I _zz_336_",
  180720. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:563.23-563.31"
  180721. }
  180722. },
  180723. "cpu_I._zz_33_": {
  180724. "hide_name": 0,
  180725. "bits": [ 3096, 3095 ],
  180726. "attributes": {
  180727. "hdlname": "cpu_I _zz_33_",
  180728. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:779.20-779.27"
  180729. }
  180730. },
  180731. "cpu_I._zz_343_": {
  180732. "hide_name": 0,
  180733. "bits": [ "0", "0" ],
  180734. "attributes": {
  180735. "hdlname": "cpu_I _zz_343_",
  180736. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:570.23-570.31"
  180737. }
  180738. },
  180739. "cpu_I._zz_345_": {
  180740. "hide_name": 0,
  180741. "bits": [ 2341 ],
  180742. "attributes": {
  180743. "hdlname": "cpu_I _zz_345_",
  180744. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:572.23-572.31"
  180745. }
  180746. },
  180747. "cpu_I._zz_346_": {
  180748. "hide_name": 0,
  180749. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7087, 3287, 3286, 2337, 7088, 2333, 2327 ],
  180750. "attributes": {
  180751. "hdlname": "cpu_I _zz_346_",
  180752. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:573.23-573.31",
  180753. "unused_bits": "10 14"
  180754. }
  180755. },
  180756. "cpu_I._zz_347_": {
  180757. "hide_name": 0,
  180758. "bits": [ "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180759. "attributes": {
  180760. "hdlname": "cpu_I _zz_347_",
  180761. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:574.23-574.31"
  180762. }
  180763. },
  180764. "cpu_I._zz_348_": {
  180765. "hide_name": 0,
  180766. "bits": [ "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180767. "attributes": {
  180768. "hdlname": "cpu_I _zz_348_",
  180769. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:575.23-575.31"
  180770. }
  180771. },
  180772. "cpu_I._zz_349_": {
  180773. "hide_name": 0,
  180774. "bits": [ "0", "0", "1", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180775. "attributes": {
  180776. "hdlname": "cpu_I _zz_349_",
  180777. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:576.23-576.31"
  180778. }
  180779. },
  180780. "cpu_I._zz_34_": {
  180781. "hide_name": 0,
  180782. "bits": [ 4278, 4277 ],
  180783. "attributes": {
  180784. "hdlname": "cpu_I _zz_34_",
  180785. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:781.20-781.27"
  180786. }
  180787. },
  180788. "cpu_I._zz_350_": {
  180789. "hide_name": 0,
  180790. "bits": [ "0", "0", 2328, "0", 1543, "0", "0", "0", "0", "0", "0", "0", "0", 1537, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180791. "attributes": {
  180792. "hdlname": "cpu_I _zz_350_",
  180793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:577.23-577.31"
  180794. }
  180795. },
  180796. "cpu_I._zz_351_": {
  180797. "hide_name": 0,
  180798. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180799. "attributes": {
  180800. "hdlname": "cpu_I _zz_351_",
  180801. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:578.23-578.31"
  180802. }
  180803. },
  180804. "cpu_I._zz_352_": {
  180805. "hide_name": 0,
  180806. "bits": [ "0", "0", 2328, "0", 1543, 2329, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1528, "0" ],
  180807. "attributes": {
  180808. "hdlname": "cpu_I _zz_352_",
  180809. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:579.23-579.31"
  180810. }
  180811. },
  180812. "cpu_I._zz_353_": {
  180813. "hide_name": 0,
  180814. "bits": [ "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0" ],
  180815. "attributes": {
  180816. "hdlname": "cpu_I _zz_353_",
  180817. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:580.23-580.31"
  180818. }
  180819. },
  180820. "cpu_I._zz_354_": {
  180821. "hide_name": 0,
  180822. "bits": [ "0", "0", "0", "0", 1543, "0", "0", "0", "0", "0", "0", "0", "0", 1537, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180823. "attributes": {
  180824. "hdlname": "cpu_I _zz_354_",
  180825. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:581.23-581.31"
  180826. }
  180827. },
  180828. "cpu_I._zz_355_": {
  180829. "hide_name": 0,
  180830. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180831. "attributes": {
  180832. "hdlname": "cpu_I _zz_355_",
  180833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:582.23-582.31"
  180834. }
  180835. },
  180836. "cpu_I._zz_356_": {
  180837. "hide_name": 0,
  180838. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1362, "0", 1536, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180839. "attributes": {
  180840. "hdlname": "cpu_I _zz_356_",
  180841. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:583.23-583.31"
  180842. }
  180843. },
  180844. "cpu_I._zz_357_": {
  180845. "hide_name": 0,
  180846. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180847. "attributes": {
  180848. "hdlname": "cpu_I _zz_357_",
  180849. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:584.23-584.31"
  180850. }
  180851. },
  180852. "cpu_I._zz_35_": {
  180853. "hide_name": 0,
  180854. "bits": [ "0", "0", 4261, 4260, 4259, 3014, 3034, 3045, 3059, 4258, 3074, 2867, 2880, 4256, 2896, 4255, 2911, 4254, 4253, 4252, 2932, 4251, 4266, 2952, 4265, 4264, 4263, 4262, 2994, 4257, 4250, 4249 ],
  180855. "attributes": {
  180856. "hdlname": "cpu_I _zz_35_",
  180857. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:785.23-785.30"
  180858. }
  180859. },
  180860. "cpu_I._zz_361_": {
  180861. "hide_name": 0,
  180862. "bits": [ 7089, 3276, 7090 ],
  180863. "attributes": {
  180864. "hdlname": "cpu_I _zz_361_",
  180865. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:588.23-588.31",
  180866. "unused_bits": "0 2"
  180867. }
  180868. },
  180869. "cpu_I._zz_362_": {
  180870. "hide_name": 0,
  180871. "bits": [ 2341 ],
  180872. "attributes": {
  180873. "hdlname": "cpu_I _zz_362_",
  180874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:589.23-589.31"
  180875. }
  180876. },
  180877. "cpu_I._zz_363_": {
  180878. "hide_name": 0,
  180879. "bits": [ "0" ],
  180880. "attributes": {
  180881. "hdlname": "cpu_I _zz_363_",
  180882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:590.23-590.31"
  180883. }
  180884. },
  180885. "cpu_I._zz_364_": {
  180886. "hide_name": 0,
  180887. "bits": [ 2327 ],
  180888. "attributes": {
  180889. "hdlname": "cpu_I _zz_364_",
  180890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:591.23-591.31"
  180891. }
  180892. },
  180893. "cpu_I._zz_365_": {
  180894. "hide_name": 0,
  180895. "bits": [ 2333 ],
  180896. "attributes": {
  180897. "hdlname": "cpu_I _zz_365_",
  180898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:592.23-592.31"
  180899. }
  180900. },
  180901. "cpu_I._zz_366_": {
  180902. "hide_name": 0,
  180903. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7091, 3287, 3286, 2337, 7092 ],
  180904. "attributes": {
  180905. "hdlname": "cpu_I _zz_366_",
  180906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:593.23-593.31",
  180907. "unused_bits": "10 14"
  180908. }
  180909. },
  180910. "cpu_I._zz_367_": {
  180911. "hide_name": 0,
  180912. "bits": [ "0", "0", "1", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180913. "attributes": {
  180914. "hdlname": "cpu_I _zz_367_",
  180915. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:594.23-594.31"
  180916. }
  180917. },
  180918. "cpu_I._zz_368_": {
  180919. "hide_name": 0,
  180920. "bits": [ "0", "0", "1", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180921. "attributes": {
  180922. "hdlname": "cpu_I _zz_368_",
  180923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:595.23-595.31"
  180924. }
  180925. },
  180926. "cpu_I._zz_369_": {
  180927. "hide_name": 0,
  180928. "bits": [ "0", "0", 2328, "0", "0", "0", 1363, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180929. "attributes": {
  180930. "hdlname": "cpu_I _zz_369_",
  180931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:596.23-596.31"
  180932. }
  180933. },
  180934. "cpu_I._zz_36_": {
  180935. "hide_name": 0,
  180936. "bits": [ 2872, 2871 ],
  180937. "attributes": {
  180938. "hdlname": "cpu_I _zz_36_",
  180939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:787.20-787.27"
  180940. }
  180941. },
  180942. "cpu_I._zz_370_": {
  180943. "hide_name": 0,
  180944. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  180945. "attributes": {
  180946. "hdlname": "cpu_I _zz_370_",
  180947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:597.23-597.31"
  180948. }
  180949. },
  180950. "cpu_I._zz_371_": {
  180951. "hide_name": 0,
  180952. "bits": [ 7090 ],
  180953. "attributes": {
  180954. "hdlname": "cpu_I _zz_371_",
  180955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:598.23-598.31",
  180956. "unused_bits": "0 "
  180957. }
  180958. },
  180959. "cpu_I._zz_372_": {
  180960. "hide_name": 0,
  180961. "bits": [ 3276 ],
  180962. "attributes": {
  180963. "hdlname": "cpu_I _zz_372_",
  180964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:599.23-599.31"
  180965. }
  180966. },
  180967. "cpu_I._zz_372__SB_LUT4_I1_O": {
  180968. "hide_name": 0,
  180969. "bits": [ 1365, 3277, 3284, 3279 ],
  180970. "attributes": {
  180971. "force_downto": "00000000000000000000000000000001",
  180972. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  180973. }
  180974. },
  180975. "cpu_I._zz_373_": {
  180976. "hide_name": 0,
  180977. "bits": [ 7089 ],
  180978. "attributes": {
  180979. "hdlname": "cpu_I _zz_373_",
  180980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:600.23-600.31",
  180981. "unused_bits": "0 "
  180982. }
  180983. },
  180984. "cpu_I._zz_374_": {
  180985. "hide_name": 0,
  180986. "bits": [ "0", "0", 2328, "0", "0", 2329, 1363, "0", "0", "0", "0", "0", "0", "0", 1536, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1548, "0", "0", "0", "0", "0", "0" ],
  180987. "attributes": {
  180988. "hdlname": "cpu_I _zz_374_",
  180989. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:601.23-601.31"
  180990. }
  180991. },
  180992. "cpu_I._zz_375_": {
  180993. "hide_name": 0,
  180994. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0" ],
  180995. "attributes": {
  180996. "hdlname": "cpu_I _zz_375_",
  180997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:602.23-602.31"
  180998. }
  180999. },
  181000. "cpu_I._zz_376_": {
  181001. "hide_name": 0,
  181002. "bits": [ 7093, 7094, 7095, 7096, 2328 ],
  181003. "attributes": {
  181004. "hdlname": "cpu_I _zz_376_",
  181005. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:603.23-603.31",
  181006. "unused_bits": "0 1 2 3"
  181007. }
  181008. },
  181009. "cpu_I._zz_377_": {
  181010. "hide_name": 0,
  181011. "bits": [ "0", "0", "0", "0", "0" ],
  181012. "attributes": {
  181013. "hdlname": "cpu_I _zz_377_",
  181014. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:604.23-604.31"
  181015. }
  181016. },
  181017. "cpu_I._zz_379_": {
  181018. "hide_name": 0,
  181019. "bits": [ 2337 ],
  181020. "attributes": {
  181021. "hdlname": "cpu_I _zz_379_",
  181022. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:606.23-606.31"
  181023. }
  181024. },
  181025. "cpu_I._zz_37_": {
  181026. "hide_name": 0,
  181027. "bits": [ 2758, 2757 ],
  181028. "attributes": {
  181029. "hdlname": "cpu_I _zz_37_",
  181030. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:789.20-789.27"
  181031. }
  181032. },
  181033. "cpu_I._zz_380_": {
  181034. "hide_name": 0,
  181035. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7097, 3287, 3286 ],
  181036. "attributes": {
  181037. "hdlname": "cpu_I _zz_380_",
  181038. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:607.23-607.31",
  181039. "unused_bits": "10 "
  181040. }
  181041. },
  181042. "cpu_I._zz_381_": {
  181043. "hide_name": 0,
  181044. "bits": [ "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181045. "attributes": {
  181046. "hdlname": "cpu_I _zz_381_",
  181047. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:608.23-608.31"
  181048. }
  181049. },
  181050. "cpu_I._zz_382_": {
  181051. "hide_name": 0,
  181052. "bits": [ 7096 ],
  181053. "attributes": {
  181054. "hdlname": "cpu_I _zz_382_",
  181055. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:609.23-609.31",
  181056. "unused_bits": "0 "
  181057. }
  181058. },
  181059. "cpu_I._zz_383_": {
  181060. "hide_name": 0,
  181061. "bits": [ 7095 ],
  181062. "attributes": {
  181063. "hdlname": "cpu_I _zz_383_",
  181064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:610.23-610.31",
  181065. "unused_bits": "0 "
  181066. }
  181067. },
  181068. "cpu_I._zz_384_": {
  181069. "hide_name": 0,
  181070. "bits": [ 7093, 7094 ],
  181071. "attributes": {
  181072. "hdlname": "cpu_I _zz_384_",
  181073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:611.23-611.31",
  181074. "unused_bits": "0 1"
  181075. }
  181076. },
  181077. "cpu_I._zz_385_": {
  181078. "hide_name": 0,
  181079. "bits": [ "0", "0", "0", 1364, "0", "0", 1363, "0", "0", "0", "0", "0", 1362, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181080. "attributes": {
  181081. "hdlname": "cpu_I _zz_385_",
  181082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:612.23-612.31"
  181083. }
  181084. },
  181085. "cpu_I._zz_386_": {
  181086. "hide_name": 0,
  181087. "bits": [ "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181088. "attributes": {
  181089. "hdlname": "cpu_I _zz_386_",
  181090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:613.23-613.31"
  181091. }
  181092. },
  181093. "cpu_I._zz_389_": {
  181094. "hide_name": 0,
  181095. "bits": [ 3286 ],
  181096. "attributes": {
  181097. "hdlname": "cpu_I _zz_389_",
  181098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:616.23-616.31"
  181099. }
  181100. },
  181101. "cpu_I._zz_389__SB_LUT4_O_I3": {
  181102. "hide_name": 0,
  181103. "bits": [ 1540, 3285 ],
  181104. "attributes": {
  181105. "force_downto": "00000000000000000000000000000001",
  181106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181107. }
  181108. },
  181109. "cpu_I._zz_38_": {
  181110. "hide_name": 0,
  181111. "bits": [ 1247, 1246 ],
  181112. "attributes": {
  181113. "hdlname": "cpu_I _zz_38_",
  181114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:795.20-795.27"
  181115. }
  181116. },
  181117. "cpu_I._zz_390_": {
  181118. "hide_name": 0,
  181119. "bits": [ "0" ],
  181120. "attributes": {
  181121. "hdlname": "cpu_I _zz_390_",
  181122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:617.23-617.31"
  181123. }
  181124. },
  181125. "cpu_I._zz_391_": {
  181126. "hide_name": 0,
  181127. "bits": [ 3287 ],
  181128. "attributes": {
  181129. "hdlname": "cpu_I _zz_391_",
  181130. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:618.23-618.31"
  181131. }
  181132. },
  181133. "cpu_I._zz_393_": {
  181134. "hide_name": 0,
  181135. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362 ],
  181136. "attributes": {
  181137. "hdlname": "cpu_I _zz_393_",
  181138. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:620.23-620.31"
  181139. }
  181140. },
  181141. "cpu_I._zz_394_": {
  181142. "hide_name": 0,
  181143. "bits": [ "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181144. "attributes": {
  181145. "hdlname": "cpu_I _zz_394_",
  181146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:621.23-621.31"
  181147. }
  181148. },
  181149. "cpu_I._zz_395_": {
  181150. "hide_name": 0,
  181151. "bits": [ "0", "0", "0", "0", "0", 2329, 1363, "0", "0", "0", "0", "0", "0", 1537, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1548, "0", "0", "0", "0", "0", "0" ],
  181152. "attributes": {
  181153. "hdlname": "cpu_I _zz_395_",
  181154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:622.23-622.31"
  181155. }
  181156. },
  181157. "cpu_I._zz_396_": {
  181158. "hide_name": 0,
  181159. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181160. "attributes": {
  181161. "hdlname": "cpu_I _zz_396_",
  181162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:623.23-623.31"
  181163. }
  181164. },
  181165. "cpu_I._zz_397_": {
  181166. "hide_name": 0,
  181167. "bits": [ "0", "0", "0", "0", "0", 2329, "0", "0", "0", "0", "0", "0", 1362, 1537, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1548, "0", "0", "0", "0", "0", "0" ],
  181168. "attributes": {
  181169. "hdlname": "cpu_I _zz_397_",
  181170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:624.23-624.31"
  181171. }
  181172. },
  181173. "cpu_I._zz_398_": {
  181174. "hide_name": 0,
  181175. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181176. "attributes": {
  181177. "hdlname": "cpu_I _zz_398_",
  181178. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:625.23-625.31"
  181179. }
  181180. },
  181181. "cpu_I._zz_399_": {
  181182. "hide_name": 0,
  181183. "bits": [ "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181184. "attributes": {
  181185. "hdlname": "cpu_I _zz_399_",
  181186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:626.23-626.31"
  181187. }
  181188. },
  181189. "cpu_I._zz_39_": {
  181190. "hide_name": 0,
  181191. "bits": [ 1250, 966 ],
  181192. "attributes": {
  181193. "hdlname": "cpu_I _zz_39_",
  181194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:799.20-799.27"
  181195. }
  181196. },
  181197. "cpu_I._zz_3_": {
  181198. "hide_name": 0,
  181199. "bits": [ 2331, 2330 ],
  181200. "attributes": {
  181201. "hdlname": "cpu_I _zz_3_",
  181202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:677.20-677.26"
  181203. }
  181204. },
  181205. "cpu_I._zz_400_": {
  181206. "hide_name": 0,
  181207. "bits": [ "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181208. "attributes": {
  181209. "hdlname": "cpu_I _zz_400_",
  181210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:627.23-627.31"
  181211. }
  181212. },
  181213. "cpu_I._zz_401_": {
  181214. "hide_name": 0,
  181215. "bits": [ "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0" ],
  181216. "attributes": {
  181217. "hdlname": "cpu_I _zz_401_",
  181218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:628.23-628.31"
  181219. }
  181220. },
  181221. "cpu_I._zz_402_": {
  181222. "hide_name": 0,
  181223. "bits": [ "0", "0", "0", "0", 1543, "0", 1363, "0", "0", "0", "0", "0", 1362, 1537, "0", "0", "0", "0", "0", "0", "0", "0", 1551, "0", "0", "0", "0", "0", 1540, "0", "0", "0" ],
  181224. "attributes": {
  181225. "hdlname": "cpu_I _zz_402_",
  181226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:629.23-629.31"
  181227. }
  181228. },
  181229. "cpu_I._zz_403_": {
  181230. "hide_name": 0,
  181231. "bits": [ "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0" ],
  181232. "attributes": {
  181233. "hdlname": "cpu_I _zz_403_",
  181234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:630.23-630.31"
  181235. }
  181236. },
  181237. "cpu_I._zz_405_": {
  181238. "hide_name": 0,
  181239. "bits": [ 1362 ],
  181240. "attributes": {
  181241. "hdlname": "cpu_I _zz_405_",
  181242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:632.23-632.31"
  181243. }
  181244. },
  181245. "cpu_I._zz_406_": {
  181246. "hide_name": 0,
  181247. "bits": [ "0" ],
  181248. "attributes": {
  181249. "hdlname": "cpu_I _zz_406_",
  181250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:633.23-633.31"
  181251. }
  181252. },
  181253. "cpu_I._zz_407_": {
  181254. "hide_name": 0,
  181255. "bits": [ 3288 ],
  181256. "attributes": {
  181257. "hdlname": "cpu_I _zz_407_",
  181258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:634.23-634.31"
  181259. }
  181260. },
  181261. "cpu_I._zz_408_": {
  181262. "hide_name": 0,
  181263. "bits": [ 3289 ],
  181264. "attributes": {
  181265. "hdlname": "cpu_I _zz_408_",
  181266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:635.23-635.31"
  181267. }
  181268. },
  181269. "cpu_I._zz_409_": {
  181270. "hide_name": 0,
  181271. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276 ],
  181272. "attributes": {
  181273. "hdlname": "cpu_I _zz_409_",
  181274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:636.23-636.31"
  181275. }
  181276. },
  181277. "cpu_I._zz_40_": {
  181278. "hide_name": 0,
  181279. "bits": [ "x", "x", "x", "x", "x", "x", "x", 2268, 2267, 2266, 2265, 2264, 7098, 7099, 7100, "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 7101, 7102, "x", "x" ],
  181280. "attributes": {
  181281. "hdlname": "cpu_I _zz_40_",
  181282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:800.23-800.30",
  181283. "unused_bits": "12 13 14 28 29"
  181284. }
  181285. },
  181286. "cpu_I._zz_410_": {
  181287. "hide_name": 0,
  181288. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181289. "attributes": {
  181290. "hdlname": "cpu_I _zz_410_",
  181291. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:637.23-637.31"
  181292. }
  181293. },
  181294. "cpu_I._zz_411_": {
  181295. "hide_name": 0,
  181296. "bits": [ "0", "0", 2328, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1536, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181297. "attributes": {
  181298. "hdlname": "cpu_I _zz_411_",
  181299. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:638.23-638.31"
  181300. }
  181301. },
  181302. "cpu_I._zz_412_": {
  181303. "hide_name": 0,
  181304. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181305. "attributes": {
  181306. "hdlname": "cpu_I _zz_412_",
  181307. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:639.23-639.31"
  181308. }
  181309. },
  181310. "cpu_I._zz_413_": {
  181311. "hide_name": 0,
  181312. "bits": [ 7103, 7104, 7105, 2328, 1363 ],
  181313. "attributes": {
  181314. "hdlname": "cpu_I _zz_413_",
  181315. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:640.23-640.31",
  181316. "unused_bits": "0 1 2"
  181317. }
  181318. },
  181319. "cpu_I._zz_414_": {
  181320. "hide_name": 0,
  181321. "bits": [ "0", "0", "0", "0", "0" ],
  181322. "attributes": {
  181323. "hdlname": "cpu_I _zz_414_",
  181324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:641.23-641.31"
  181325. }
  181326. },
  181327. "cpu_I._zz_415_": {
  181328. "hide_name": 0,
  181329. "bits": [ 3291 ],
  181330. "attributes": {
  181331. "hdlname": "cpu_I _zz_415_",
  181332. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:642.23-642.31"
  181333. }
  181334. },
  181335. "cpu_I._zz_415__SB_LUT4_O_I2": {
  181336. "hide_name": 0,
  181337. "bits": [ 2334, 3290, 2335 ],
  181338. "attributes": {
  181339. "force_downto": "00000000000000000000000000000001",
  181340. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181341. }
  181342. },
  181343. "cpu_I._zz_416_": {
  181344. "hide_name": 0,
  181345. "bits": [ 3294 ],
  181346. "attributes": {
  181347. "hdlname": "cpu_I _zz_416_",
  181348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:643.23-643.31"
  181349. }
  181350. },
  181351. "cpu_I._zz_416__SB_LUT4_O_I1": {
  181352. "hide_name": 0,
  181353. "bits": [ 1363, 3292 ],
  181354. "attributes": {
  181355. "force_downto": "00000000000000000000000000000001",
  181356. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181357. }
  181358. },
  181359. "cpu_I._zz_416__SB_LUT4_O_I1_SB_LUT4_I3_O": {
  181360. "hide_name": 0,
  181361. "bits": [ 1537, 1362, 2334, 2335 ],
  181362. "attributes": {
  181363. "force_downto": "00000000000000000000000000000001",
  181364. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181365. }
  181366. },
  181367. "cpu_I._zz_416__SB_LUT4_O_I3": {
  181368. "hide_name": 0,
  181369. "bits": [ 1537, 3292, 2343, 3293 ],
  181370. "attributes": {
  181371. "force_downto": "00000000000000000000000000000001",
  181372. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181373. }
  181374. },
  181375. "cpu_I._zz_416__SB_LUT4_O_I3_SB_LUT4_O_I3": {
  181376. "hide_name": 0,
  181377. "bits": [ 1528, 1548, 1536, 3295 ],
  181378. "attributes": {
  181379. "force_downto": "00000000000000000000000000000001",
  181380. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181381. }
  181382. },
  181383. "cpu_I._zz_417_": {
  181384. "hide_name": 0,
  181385. "bits": [ 2331, 2330, 2591 ],
  181386. "attributes": {
  181387. "hdlname": "cpu_I _zz_417_",
  181388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:644.23-644.31"
  181389. }
  181390. },
  181391. "cpu_I._zz_418_": {
  181392. "hide_name": 0,
  181393. "bits": [ "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181394. "attributes": {
  181395. "hdlname": "cpu_I _zz_418_",
  181396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:645.23-645.31"
  181397. }
  181398. },
  181399. "cpu_I._zz_419_": {
  181400. "hide_name": 0,
  181401. "bits": [ 7105 ],
  181402. "attributes": {
  181403. "hdlname": "cpu_I _zz_419_",
  181404. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:646.23-646.31",
  181405. "unused_bits": "0 "
  181406. }
  181407. },
  181408. "cpu_I._zz_41_": {
  181409. "hide_name": 0,
  181410. "bits": [ 2325 ],
  181411. "attributes": {
  181412. "hdlname": "cpu_I _zz_41_",
  181413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:801.23-801.30"
  181414. }
  181415. },
  181416. "cpu_I._zz_420_": {
  181417. "hide_name": 0,
  181418. "bits": [ 7104 ],
  181419. "attributes": {
  181420. "hdlname": "cpu_I _zz_420_",
  181421. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:647.23-647.31",
  181422. "unused_bits": "0 "
  181423. }
  181424. },
  181425. "cpu_I._zz_421_": {
  181426. "hide_name": 0,
  181427. "bits": [ 7103 ],
  181428. "attributes": {
  181429. "hdlname": "cpu_I _zz_421_",
  181430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:648.23-648.31",
  181431. "unused_bits": "0 "
  181432. }
  181433. },
  181434. "cpu_I._zz_422_": {
  181435. "hide_name": 0,
  181436. "bits": [ "0", "0", 2328, "0", 1543, 2329, "0", "0", "0", "0", "0", "0", 1362, 1537, 1536, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181437. "attributes": {
  181438. "hdlname": "cpu_I _zz_422_",
  181439. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:649.23-649.31"
  181440. }
  181441. },
  181442. "cpu_I._zz_423_": {
  181443. "hide_name": 0,
  181444. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181445. "attributes": {
  181446. "hdlname": "cpu_I _zz_423_",
  181447. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:650.23-650.31"
  181448. }
  181449. },
  181450. "cpu_I._zz_424_": {
  181451. "hide_name": 0,
  181452. "bits": [ "0", "0", 2328, "0", "0", 2329, 1363, "0", "0", "0", "0", "0", 1362, 1537, 1536, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 1548, "0", "0", "0", "0", "0", "0" ],
  181453. "attributes": {
  181454. "hdlname": "cpu_I _zz_424_",
  181455. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:651.23-651.31"
  181456. }
  181457. },
  181458. "cpu_I._zz_425_": {
  181459. "hide_name": 0,
  181460. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "1", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181461. "attributes": {
  181462. "hdlname": "cpu_I _zz_425_",
  181463. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:652.23-652.31"
  181464. }
  181465. },
  181466. "cpu_I._zz_429_": {
  181467. "hide_name": 0,
  181468. "bits": [ 2591 ],
  181469. "attributes": {
  181470. "hdlname": "cpu_I _zz_429_",
  181471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:656.23-656.31"
  181472. }
  181473. },
  181474. "cpu_I._zz_430_": {
  181475. "hide_name": 0,
  181476. "bits": [ 7106, 2328 ],
  181477. "attributes": {
  181478. "hdlname": "cpu_I _zz_430_",
  181479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:657.23-657.31",
  181480. "unused_bits": "0 "
  181481. }
  181482. },
  181483. "cpu_I._zz_431_": {
  181484. "hide_name": 0,
  181485. "bits": [ "0", "0" ],
  181486. "attributes": {
  181487. "hdlname": "cpu_I _zz_431_",
  181488. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:658.23-658.31"
  181489. }
  181490. },
  181491. "cpu_I._zz_432_": {
  181492. "hide_name": 0,
  181493. "bits": [ 7107, 2328 ],
  181494. "attributes": {
  181495. "hdlname": "cpu_I _zz_432_",
  181496. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:659.23-659.31",
  181497. "unused_bits": "0 "
  181498. }
  181499. },
  181500. "cpu_I._zz_433_": {
  181501. "hide_name": 0,
  181502. "bits": [ "0", "0" ],
  181503. "attributes": {
  181504. "hdlname": "cpu_I _zz_433_",
  181505. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:660.23-660.31"
  181506. }
  181507. },
  181508. "cpu_I._zz_434_": {
  181509. "hide_name": 0,
  181510. "bits": [ "0", "0", "0", "0", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181511. "attributes": {
  181512. "hdlname": "cpu_I _zz_434_",
  181513. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:661.23-661.31"
  181514. }
  181515. },
  181516. "cpu_I._zz_435_": {
  181517. "hide_name": 0,
  181518. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0" ],
  181519. "attributes": {
  181520. "hdlname": "cpu_I _zz_435_",
  181521. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:662.23-662.31"
  181522. }
  181523. },
  181524. "cpu_I._zz_436_": {
  181525. "hide_name": 0,
  181526. "bits": [ "0", "0", "1", "0", "1", "1", "0", "0", "0", "0", "0", "0", "1", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181527. "attributes": {
  181528. "hdlname": "cpu_I _zz_436_",
  181529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:663.23-663.31"
  181530. }
  181531. },
  181532. "cpu_I._zz_437_": {
  181533. "hide_name": 0,
  181534. "bits": [ "0", "0", "1", "0", "1", "0", "1", "0", "0", "0", "0", "0", "1", "1", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0" ],
  181535. "attributes": {
  181536. "hdlname": "cpu_I _zz_437_",
  181537. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:664.23-664.31"
  181538. }
  181539. },
  181540. "cpu_I._zz_438_": {
  181541. "hide_name": 0,
  181542. "bits": [ "0", "0", "0", "0", 1543, 2329, 1363, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181543. "attributes": {
  181544. "hdlname": "cpu_I _zz_438_",
  181545. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:665.23-665.31"
  181546. }
  181547. },
  181548. "cpu_I._zz_439_": {
  181549. "hide_name": 0,
  181550. "bits": [ "0", "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181551. "attributes": {
  181552. "hdlname": "cpu_I _zz_439_",
  181553. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:666.23-666.31"
  181554. }
  181555. },
  181556. "cpu_I._zz_43_": {
  181557. "hide_name": 0,
  181558. "bits": [ 1822, 1823 ],
  181559. "attributes": {
  181560. "hdlname": "cpu_I _zz_43_",
  181561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:805.20-805.27"
  181562. }
  181563. },
  181564. "cpu_I._zz_440_": {
  181565. "hide_name": 0,
  181566. "bits": [ "0", "0", "0", "0", "0", 2329, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181567. "attributes": {
  181568. "hdlname": "cpu_I _zz_440_",
  181569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:667.23-667.31"
  181570. }
  181571. },
  181572. "cpu_I._zz_441_": {
  181573. "hide_name": 0,
  181574. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  181575. "attributes": {
  181576. "hdlname": "cpu_I _zz_441_",
  181577. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:668.23-668.31"
  181578. }
  181579. },
  181580. "cpu_I._zz_442_": {
  181581. "hide_name": 0,
  181582. "bits": [ 943 ],
  181583. "attributes": {
  181584. "hdlname": "cpu_I _zz_442_",
  181585. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:669.23-669.31"
  181586. }
  181587. },
  181588. "cpu_I._zz_443_": {
  181589. "hide_name": 0,
  181590. "bits": [ 943 ],
  181591. "attributes": {
  181592. "hdlname": "cpu_I _zz_443_",
  181593. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:670.23-670.31"
  181594. }
  181595. },
  181596. "cpu_I._zz_444_": {
  181597. "hide_name": 0,
  181598. "bits": [ 978 ],
  181599. "attributes": {
  181600. "hdlname": "cpu_I _zz_444_",
  181601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:671.23-671.31"
  181602. }
  181603. },
  181604. "cpu_I._zz_44_": {
  181605. "hide_name": 0,
  181606. "bits": [ 2857, 2856 ],
  181607. "attributes": {
  181608. "hdlname": "cpu_I _zz_44_",
  181609. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:806.20-806.27"
  181610. }
  181611. },
  181612. "cpu_I._zz_45_": {
  181613. "hide_name": 0,
  181614. "bits": [ 3287, 3286 ],
  181615. "attributes": {
  181616. "hdlname": "cpu_I _zz_45_",
  181617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:807.20-807.27"
  181618. }
  181619. },
  181620. "cpu_I._zz_46_": {
  181621. "hide_name": 0,
  181622. "bits": [ 3288, 1362 ],
  181623. "attributes": {
  181624. "hdlname": "cpu_I _zz_46_",
  181625. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:808.20-808.27"
  181626. }
  181627. },
  181628. "cpu_I._zz_47_": {
  181629. "hide_name": 0,
  181630. "bits": [ 3276, 3289 ],
  181631. "attributes": {
  181632. "hdlname": "cpu_I _zz_47_",
  181633. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:809.20-809.27"
  181634. }
  181635. },
  181636. "cpu_I._zz_48_": {
  181637. "hide_name": 0,
  181638. "bits": [ 3294, 3291 ],
  181639. "attributes": {
  181640. "hdlname": "cpu_I _zz_48_",
  181641. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:810.20-810.27"
  181642. }
  181643. },
  181644. "cpu_I._zz_49_": {
  181645. "hide_name": 0,
  181646. "bits": [ 2331, 2330 ],
  181647. "attributes": {
  181648. "hdlname": "cpu_I _zz_49_",
  181649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:811.20-811.27"
  181650. }
  181651. },
  181652. "cpu_I._zz_4_": {
  181653. "hide_name": 0,
  181654. "bits": [ 2857, 2856 ],
  181655. "attributes": {
  181656. "hdlname": "cpu_I _zz_4_",
  181657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:683.20-683.26"
  181658. }
  181659. },
  181660. "cpu_I._zz_50_": {
  181661. "hide_name": 0,
  181662. "bits": [ 2294, 2293, 2291, 2290, 2289, 2288, 2287, 2286, 2285, 2284, 2283, 2282, 2280, 2279, 2278, 2277, 2276, 2275, 2274, 2273, 2272, 2271, 2300, 2299, 2298, 2297, 2296, 2295, 2292, 2281, 2270, 2269 ],
  181663. "attributes": {
  181664. "hdlname": "cpu_I _zz_50_",
  181665. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:813.23-813.30"
  181666. }
  181667. },
  181668. "cpu_I._zz_50__SB_LUT4_O_10_I2": {
  181669. "hide_name": 0,
  181670. "bits": [ 3301, 3302 ],
  181671. "attributes": {
  181672. "force_downto": "00000000000000000000000000000001",
  181673. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181674. }
  181675. },
  181676. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_1_I3": {
  181677. "hide_name": 0,
  181678. "bits": [ 3307, 3296, 3308, 3309 ],
  181679. "attributes": {
  181680. "force_downto": "00000000000000000000000000000001",
  181681. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181682. }
  181683. },
  181684. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181685. "hide_name": 0,
  181686. "bits": [ 3312 ],
  181687. "attributes": {
  181688. "abc9_carry": "00000000000000000000000000000001",
  181689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181690. }
  181691. },
  181692. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_I2": {
  181693. "hide_name": 0,
  181694. "bits": [ 3303, 3304, 3305, 3306 ],
  181695. "attributes": {
  181696. "force_downto": "00000000000000000000000000000001",
  181697. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181698. }
  181699. },
  181700. "cpu_I._zz_50__SB_LUT4_O_10_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  181701. "hide_name": 0,
  181702. "bits": [ 3315, 3316, 3296 ],
  181703. "attributes": {
  181704. "force_downto": "00000000000000000000000000000001",
  181705. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181706. }
  181707. },
  181708. "cpu_I._zz_50__SB_LUT4_O_11_I2": {
  181709. "hide_name": 0,
  181710. "bits": [ 3317, 3318 ],
  181711. "attributes": {
  181712. "force_downto": "00000000000000000000000000000001",
  181713. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181714. }
  181715. },
  181716. "cpu_I._zz_50__SB_LUT4_O_11_I2_SB_LUT4_O_1_I3": {
  181717. "hide_name": 0,
  181718. "bits": [ 3321, 3296, 3308, 3322 ],
  181719. "attributes": {
  181720. "force_downto": "00000000000000000000000000000001",
  181721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181722. }
  181723. },
  181724. "cpu_I._zz_50__SB_LUT4_O_11_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181725. "hide_name": 0,
  181726. "bits": [ 3324 ],
  181727. "attributes": {
  181728. "abc9_carry": "00000000000000000000000000000001",
  181729. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181730. }
  181731. },
  181732. "cpu_I._zz_50__SB_LUT4_O_12_I2": {
  181733. "hide_name": 0,
  181734. "bits": [ 3325, 3326 ],
  181735. "attributes": {
  181736. "force_downto": "00000000000000000000000000000001",
  181737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181738. }
  181739. },
  181740. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_1_I3": {
  181741. "hide_name": 0,
  181742. "bits": [ 3329, 3296, 3308, 3330 ],
  181743. "attributes": {
  181744. "force_downto": "00000000000000000000000000000001",
  181745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181746. }
  181747. },
  181748. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181749. "hide_name": 0,
  181750. "bits": [ 3332 ],
  181751. "attributes": {
  181752. "abc9_carry": "00000000000000000000000000000001",
  181753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181754. }
  181755. },
  181756. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_I2": {
  181757. "hide_name": 0,
  181758. "bits": [ 3327, 3304, 3328, 3306 ],
  181759. "attributes": {
  181760. "force_downto": "00000000000000000000000000000001",
  181761. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181762. }
  181763. },
  181764. "cpu_I._zz_50__SB_LUT4_O_12_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  181765. "hide_name": 0,
  181766. "bits": [ 3333, 3316, 3296 ],
  181767. "attributes": {
  181768. "force_downto": "00000000000000000000000000000001",
  181769. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181770. }
  181771. },
  181772. "cpu_I._zz_50__SB_LUT4_O_13_I2": {
  181773. "hide_name": 0,
  181774. "bits": [ 3334, 3335 ],
  181775. "attributes": {
  181776. "force_downto": "00000000000000000000000000000001",
  181777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181778. }
  181779. },
  181780. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_1_I3": {
  181781. "hide_name": 0,
  181782. "bits": [ 3338, 3296, 3308, 3339 ],
  181783. "attributes": {
  181784. "force_downto": "00000000000000000000000000000001",
  181785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181786. }
  181787. },
  181788. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181789. "hide_name": 0,
  181790. "bits": [ 3341 ],
  181791. "attributes": {
  181792. "abc9_carry": "00000000000000000000000000000001",
  181793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181794. }
  181795. },
  181796. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_I2": {
  181797. "hide_name": 0,
  181798. "bits": [ 3336, 3304, 3337, 3306 ],
  181799. "attributes": {
  181800. "force_downto": "00000000000000000000000000000001",
  181801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181802. }
  181803. },
  181804. "cpu_I._zz_50__SB_LUT4_O_13_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  181805. "hide_name": 0,
  181806. "bits": [ 3342, 3316, 3296 ],
  181807. "attributes": {
  181808. "force_downto": "00000000000000000000000000000001",
  181809. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181810. }
  181811. },
  181812. "cpu_I._zz_50__SB_LUT4_O_14_I2": {
  181813. "hide_name": 0,
  181814. "bits": [ 3343, 3344 ],
  181815. "attributes": {
  181816. "force_downto": "00000000000000000000000000000001",
  181817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181818. }
  181819. },
  181820. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_1_I3": {
  181821. "hide_name": 0,
  181822. "bits": [ 3347, 3296, 3308, 3348 ],
  181823. "attributes": {
  181824. "force_downto": "00000000000000000000000000000001",
  181825. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181826. }
  181827. },
  181828. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181829. "hide_name": 0,
  181830. "bits": [ 3350 ],
  181831. "attributes": {
  181832. "abc9_carry": "00000000000000000000000000000001",
  181833. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181834. }
  181835. },
  181836. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_I2": {
  181837. "hide_name": 0,
  181838. "bits": [ 3345, 3304, 3346, 3306 ],
  181839. "attributes": {
  181840. "force_downto": "00000000000000000000000000000001",
  181841. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181842. }
  181843. },
  181844. "cpu_I._zz_50__SB_LUT4_O_14_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  181845. "hide_name": 0,
  181846. "bits": [ 3351, 3316, 3296 ],
  181847. "attributes": {
  181848. "force_downto": "00000000000000000000000000000001",
  181849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181850. }
  181851. },
  181852. "cpu_I._zz_50__SB_LUT4_O_15_I2": {
  181853. "hide_name": 0,
  181854. "bits": [ 3352, 3353 ],
  181855. "attributes": {
  181856. "force_downto": "00000000000000000000000000000001",
  181857. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181858. }
  181859. },
  181860. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_1_I3": {
  181861. "hide_name": 0,
  181862. "bits": [ 3356, 3296, 3308, 3357 ],
  181863. "attributes": {
  181864. "force_downto": "00000000000000000000000000000001",
  181865. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181866. }
  181867. },
  181868. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181869. "hide_name": 0,
  181870. "bits": [ 3359 ],
  181871. "attributes": {
  181872. "abc9_carry": "00000000000000000000000000000001",
  181873. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181874. }
  181875. },
  181876. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_I2": {
  181877. "hide_name": 0,
  181878. "bits": [ 3354, 3304, 3355, 3306 ],
  181879. "attributes": {
  181880. "force_downto": "00000000000000000000000000000001",
  181881. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181882. }
  181883. },
  181884. "cpu_I._zz_50__SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  181885. "hide_name": 0,
  181886. "bits": [ 3360, 3316, 3296 ],
  181887. "attributes": {
  181888. "force_downto": "00000000000000000000000000000001",
  181889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181890. }
  181891. },
  181892. "cpu_I._zz_50__SB_LUT4_O_16_I2": {
  181893. "hide_name": 0,
  181894. "bits": [ 3361, 3362 ],
  181895. "attributes": {
  181896. "force_downto": "00000000000000000000000000000001",
  181897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181898. }
  181899. },
  181900. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_1_I3": {
  181901. "hide_name": 0,
  181902. "bits": [ 3365, 3296, 3308, 3366 ],
  181903. "attributes": {
  181904. "force_downto": "00000000000000000000000000000001",
  181905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181906. }
  181907. },
  181908. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181909. "hide_name": 0,
  181910. "bits": [ 3368 ],
  181911. "attributes": {
  181912. "abc9_carry": "00000000000000000000000000000001",
  181913. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181914. }
  181915. },
  181916. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_I2": {
  181917. "hide_name": 0,
  181918. "bits": [ 3363, 3304, 3364, 3306 ],
  181919. "attributes": {
  181920. "force_downto": "00000000000000000000000000000001",
  181921. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181922. }
  181923. },
  181924. "cpu_I._zz_50__SB_LUT4_O_16_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  181925. "hide_name": 0,
  181926. "bits": [ 3369, 3316, 3296 ],
  181927. "attributes": {
  181928. "force_downto": "00000000000000000000000000000001",
  181929. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181930. }
  181931. },
  181932. "cpu_I._zz_50__SB_LUT4_O_17_I2": {
  181933. "hide_name": 0,
  181934. "bits": [ 3296, 3370, 3371 ],
  181935. "attributes": {
  181936. "force_downto": "00000000000000000000000000000001",
  181937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181938. }
  181939. },
  181940. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_1_I3": {
  181941. "hide_name": 0,
  181942. "bits": [ 3374, 3308, 3375 ],
  181943. "attributes": {
  181944. "force_downto": "00000000000000000000000000000001",
  181945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181946. }
  181947. },
  181948. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  181949. "hide_name": 0,
  181950. "bits": [ 3378 ],
  181951. "attributes": {
  181952. "abc9_carry": "00000000000000000000000000000001",
  181953. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181954. }
  181955. },
  181956. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_I1": {
  181957. "hide_name": 0,
  181958. "bits": [ 3372, 3316, 3373 ],
  181959. "attributes": {
  181960. "force_downto": "00000000000000000000000000000001",
  181961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181962. }
  181963. },
  181964. "cpu_I._zz_50__SB_LUT4_O_17_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  181965. "hide_name": 0,
  181966. "bits": [ 3382, 3308, 3383 ],
  181967. "attributes": {
  181968. "force_downto": "00000000000000000000000000000001",
  181969. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181970. }
  181971. },
  181972. "cpu_I._zz_50__SB_LUT4_O_18_I2": {
  181973. "hide_name": 0,
  181974. "bits": [ 3296, 3387, 3388 ],
  181975. "attributes": {
  181976. "force_downto": "00000000000000000000000000000001",
  181977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181978. }
  181979. },
  181980. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_1_I2": {
  181981. "hide_name": 0,
  181982. "bits": [ 3391, 3392, 3308 ],
  181983. "attributes": {
  181984. "force_downto": "00000000000000000000000000000001",
  181985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  181986. }
  181987. },
  181988. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  181989. "hide_name": 0,
  181990. "bits": [ 3379 ],
  181991. "attributes": {
  181992. "abc9_carry": "00000000000000000000000000000001",
  181993. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  181994. }
  181995. },
  181996. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1": {
  181997. "hide_name": 0,
  181998. "bits": [ 3389, 3316, 3390 ],
  181999. "attributes": {
  182000. "force_downto": "00000000000000000000000000000001",
  182001. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182002. }
  182003. },
  182004. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  182005. "hide_name": 0,
  182006. "bits": [ 3396, 3308, 3383 ],
  182007. "attributes": {
  182008. "force_downto": "00000000000000000000000000000001",
  182009. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182010. }
  182011. },
  182012. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I3": {
  182013. "hide_name": 0,
  182014. "bits": [ 3399, 3383 ],
  182015. "attributes": {
  182016. "force_downto": "00000000000000000000000000000001",
  182017. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182018. }
  182019. },
  182020. "cpu_I._zz_50__SB_LUT4_O_18_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_I2_O": {
  182021. "hide_name": 0,
  182022. "bits": [ 3319, 3304, 3320, 3306 ],
  182023. "attributes": {
  182024. "force_downto": "00000000000000000000000000000001",
  182025. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182026. }
  182027. },
  182028. "cpu_I._zz_50__SB_LUT4_O_19_I2": {
  182029. "hide_name": 0,
  182030. "bits": [ 3296, 3405, 3406 ],
  182031. "attributes": {
  182032. "force_downto": "00000000000000000000000000000001",
  182033. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182034. }
  182035. },
  182036. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_1_I2": {
  182037. "hide_name": 0,
  182038. "bits": [ 3408, 3409, 3308 ],
  182039. "attributes": {
  182040. "force_downto": "00000000000000000000000000000001",
  182041. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182042. }
  182043. },
  182044. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182045. "hide_name": 0,
  182046. "bits": [ 3393 ],
  182047. "attributes": {
  182048. "abc9_carry": "00000000000000000000000000000001",
  182049. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182050. }
  182051. },
  182052. "cpu_I._zz_50__SB_LUT4_O_19_I2_SB_LUT4_O_I1": {
  182053. "hide_name": 0,
  182054. "bits": [ 3407, 3316, 3404 ],
  182055. "attributes": {
  182056. "force_downto": "00000000000000000000000000000001",
  182057. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182058. }
  182059. },
  182060. "cpu_I._zz_50__SB_LUT4_O_1_I2": {
  182061. "hide_name": 0,
  182062. "bits": [ 3299, 3300 ],
  182063. "attributes": {
  182064. "force_downto": "00000000000000000000000000000001",
  182065. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182066. }
  182067. },
  182068. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_1_I3": {
  182069. "hide_name": 0,
  182070. "bits": [ 3415, 3296, 3308, 3416 ],
  182071. "attributes": {
  182072. "force_downto": "00000000000000000000000000000001",
  182073. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182074. }
  182075. },
  182076. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182077. "hide_name": 0,
  182078. "bits": [ 3419 ],
  182079. "attributes": {
  182080. "abc9_carry": "00000000000000000000000000000001",
  182081. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182082. }
  182083. },
  182084. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I1": {
  182085. "hide_name": 0,
  182086. "bits": [ 3401, 3304, 3402, 3403 ],
  182087. "attributes": {
  182088. "force_downto": "00000000000000000000000000000001",
  182089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182090. }
  182091. },
  182092. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I2": {
  182093. "hide_name": 0,
  182094. "bits": [ 3413, 3304, 3414, 3306 ],
  182095. "attributes": {
  182096. "force_downto": "00000000000000000000000000000001",
  182097. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182098. }
  182099. },
  182100. "cpu_I._zz_50__SB_LUT4_O_1_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182101. "hide_name": 0,
  182102. "bits": [ 3426, 3316, 3296 ],
  182103. "attributes": {
  182104. "force_downto": "00000000000000000000000000000001",
  182105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182106. }
  182107. },
  182108. "cpu_I._zz_50__SB_LUT4_O_20_I2": {
  182109. "hide_name": 0,
  182110. "bits": [ 3296, 3429, 3430 ],
  182111. "attributes": {
  182112. "force_downto": "00000000000000000000000000000001",
  182113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182114. }
  182115. },
  182116. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_1_I2": {
  182117. "hide_name": 0,
  182118. "bits": [ 3433, 3434, 3308 ],
  182119. "attributes": {
  182120. "force_downto": "00000000000000000000000000000001",
  182121. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182122. }
  182123. },
  182124. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182125. "hide_name": 0,
  182126. "bits": [ 3437 ],
  182127. "attributes": {
  182128. "abc9_carry": "00000000000000000000000000000001",
  182129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182130. }
  182131. },
  182132. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1": {
  182133. "hide_name": 0,
  182134. "bits": [ 3431, 3316, 3432 ],
  182135. "attributes": {
  182136. "force_downto": "00000000000000000000000000000001",
  182137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182138. }
  182139. },
  182140. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1_SB_LUT4_O_I3": {
  182141. "hide_name": 0,
  182142. "bits": [ 3441, 3442, 3443 ],
  182143. "attributes": {
  182144. "force_downto": "00000000000000000000000000000001",
  182145. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182146. }
  182147. },
  182148. "cpu_I._zz_50__SB_LUT4_O_20_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  182149. "hide_name": 0,
  182150. "bits": [ 3444, 3385, 3386, 3445 ],
  182151. "attributes": {
  182152. "force_downto": "00000000000000000000000000000001",
  182153. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182154. }
  182155. },
  182156. "cpu_I._zz_50__SB_LUT4_O_21_I2": {
  182157. "hide_name": 0,
  182158. "bits": [ 3296, 3447, 3448 ],
  182159. "attributes": {
  182160. "force_downto": "00000000000000000000000000000001",
  182161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182162. }
  182163. },
  182164. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_1_I2": {
  182165. "hide_name": 0,
  182166. "bits": [ 3452, 3453, 3308 ],
  182167. "attributes": {
  182168. "force_downto": "00000000000000000000000000000001",
  182169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182170. }
  182171. },
  182172. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182173. "hide_name": 0,
  182174. "bits": [ 3438 ],
  182175. "attributes": {
  182176. "abc9_carry": "00000000000000000000000000000001",
  182177. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182178. }
  182179. },
  182180. "cpu_I._zz_50__SB_LUT4_O_21_I2_SB_LUT4_O_I0": {
  182181. "hide_name": 0,
  182182. "bits": [ 3449, 3450, 3451, 3316 ],
  182183. "attributes": {
  182184. "force_downto": "00000000000000000000000000000001",
  182185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182186. }
  182187. },
  182188. "cpu_I._zz_50__SB_LUT4_O_22_I2": {
  182189. "hide_name": 0,
  182190. "bits": [ 3296, 3460, 3461 ],
  182191. "attributes": {
  182192. "force_downto": "00000000000000000000000000000001",
  182193. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182194. }
  182195. },
  182196. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_1_I2": {
  182197. "hide_name": 0,
  182198. "bits": [ 3465, 3466, 3308 ],
  182199. "attributes": {
  182200. "force_downto": "00000000000000000000000000000001",
  182201. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182202. }
  182203. },
  182204. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182205. "hide_name": 0,
  182206. "bits": [ 3454 ],
  182207. "attributes": {
  182208. "abc9_carry": "00000000000000000000000000000001",
  182209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182210. }
  182211. },
  182212. "cpu_I._zz_50__SB_LUT4_O_22_I2_SB_LUT4_O_I0": {
  182213. "hide_name": 0,
  182214. "bits": [ 3462, 3463, 3464, 3316 ],
  182215. "attributes": {
  182216. "force_downto": "00000000000000000000000000000001",
  182217. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182218. }
  182219. },
  182220. "cpu_I._zz_50__SB_LUT4_O_23_I2": {
  182221. "hide_name": 0,
  182222. "bits": [ 3296, 3473, 3474 ],
  182223. "attributes": {
  182224. "force_downto": "00000000000000000000000000000001",
  182225. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182226. }
  182227. },
  182228. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_1_I2": {
  182229. "hide_name": 0,
  182230. "bits": [ 3477, 3478, 3308 ],
  182231. "attributes": {
  182232. "force_downto": "00000000000000000000000000000001",
  182233. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182234. }
  182235. },
  182236. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182237. "hide_name": 0,
  182238. "bits": [ 3467 ],
  182239. "attributes": {
  182240. "abc9_carry": "00000000000000000000000000000001",
  182241. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182242. }
  182243. },
  182244. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1": {
  182245. "hide_name": 0,
  182246. "bits": [ 3475, 3316, 3476 ],
  182247. "attributes": {
  182248. "force_downto": "00000000000000000000000000000001",
  182249. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182250. }
  182251. },
  182252. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1_SB_LUT4_O_I3": {
  182253. "hide_name": 0,
  182254. "bits": [ 3482, 3442, 3483 ],
  182255. "attributes": {
  182256. "force_downto": "00000000000000000000000000000001",
  182257. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182258. }
  182259. },
  182260. "cpu_I._zz_50__SB_LUT4_O_23_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  182261. "hide_name": 0,
  182262. "bits": [ 3319, 3385, 3386, 3484 ],
  182263. "attributes": {
  182264. "force_downto": "00000000000000000000000000000001",
  182265. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182266. }
  182267. },
  182268. "cpu_I._zz_50__SB_LUT4_O_24_I2": {
  182269. "hide_name": 0,
  182270. "bits": [ 3296, 3487, 3488 ],
  182271. "attributes": {
  182272. "force_downto": "00000000000000000000000000000001",
  182273. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182274. }
  182275. },
  182276. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_1_I2": {
  182277. "hide_name": 0,
  182278. "bits": [ 3491, 3492, 3308 ],
  182279. "attributes": {
  182280. "force_downto": "00000000000000000000000000000001",
  182281. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182282. }
  182283. },
  182284. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182285. "hide_name": 0,
  182286. "bits": [ 3479 ],
  182287. "attributes": {
  182288. "abc9_carry": "00000000000000000000000000000001",
  182289. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182290. }
  182291. },
  182292. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0": {
  182293. "hide_name": 0,
  182294. "bits": [ 3489, 3316, 3296, 3490 ],
  182295. "attributes": {
  182296. "force_downto": "00000000000000000000000000000001",
  182297. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182298. }
  182299. },
  182300. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0_SB_LUT4_O_I3": {
  182301. "hide_name": 0,
  182302. "bits": [ 3495, 3442, 3496 ],
  182303. "attributes": {
  182304. "force_downto": "00000000000000000000000000000001",
  182305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182306. }
  182307. },
  182308. "cpu_I._zz_50__SB_LUT4_O_24_I2_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  182309. "hide_name": 0,
  182310. "bits": [ 3384, 3385, 3386, 3497 ],
  182311. "attributes": {
  182312. "force_downto": "00000000000000000000000000000001",
  182313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182314. }
  182315. },
  182316. "cpu_I._zz_50__SB_LUT4_O_25_I2": {
  182317. "hide_name": 0,
  182318. "bits": [ 3296, 3499, 3500 ],
  182319. "attributes": {
  182320. "force_downto": "00000000000000000000000000000001",
  182321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182322. }
  182323. },
  182324. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_1_I3": {
  182325. "hide_name": 0,
  182326. "bits": [ 3503, 3308, 3504 ],
  182327. "attributes": {
  182328. "force_downto": "00000000000000000000000000000001",
  182329. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182330. }
  182331. },
  182332. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182333. "hide_name": 0,
  182334. "bits": [ 3420 ],
  182335. "attributes": {
  182336. "abc9_carry": "00000000000000000000000000000001",
  182337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182338. }
  182339. },
  182340. "cpu_I._zz_50__SB_LUT4_O_25_I2_SB_LUT4_O_I1": {
  182341. "hide_name": 0,
  182342. "bits": [ 3501, 3316, 3502 ],
  182343. "attributes": {
  182344. "force_downto": "00000000000000000000000000000001",
  182345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182346. }
  182347. },
  182348. "cpu_I._zz_50__SB_LUT4_O_26_I2": {
  182349. "hide_name": 0,
  182350. "bits": [ 3296, 3508, 3509 ],
  182351. "attributes": {
  182352. "force_downto": "00000000000000000000000000000001",
  182353. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182354. }
  182355. },
  182356. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_1_I3": {
  182357. "hide_name": 0,
  182358. "bits": [ 3512, 3308, 3513 ],
  182359. "attributes": {
  182360. "force_downto": "00000000000000000000000000000001",
  182361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182362. }
  182363. },
  182364. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182365. "hide_name": 0,
  182366. "bits": [ 3505 ],
  182367. "attributes": {
  182368. "abc9_carry": "00000000000000000000000000000001",
  182369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182370. }
  182371. },
  182372. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_I1": {
  182373. "hide_name": 0,
  182374. "bits": [ 3510, 3316, 3511 ],
  182375. "attributes": {
  182376. "force_downto": "00000000000000000000000000000001",
  182377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182378. }
  182379. },
  182380. "cpu_I._zz_50__SB_LUT4_O_26_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  182381. "hide_name": 0,
  182382. "bits": [ 3517, 3308, 3383 ],
  182383. "attributes": {
  182384. "force_downto": "00000000000000000000000000000001",
  182385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182386. }
  182387. },
  182388. "cpu_I._zz_50__SB_LUT4_O_27_I2": {
  182389. "hide_name": 0,
  182390. "bits": [ 3296, 3519, 3520 ],
  182391. "attributes": {
  182392. "force_downto": "00000000000000000000000000000001",
  182393. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182394. }
  182395. },
  182396. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_1_I3": {
  182397. "hide_name": 0,
  182398. "bits": [ 3523, 3308, 3524 ],
  182399. "attributes": {
  182400. "force_downto": "00000000000000000000000000000001",
  182401. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182402. }
  182403. },
  182404. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182405. "hide_name": 0,
  182406. "bits": [ 3514 ],
  182407. "attributes": {
  182408. "abc9_carry": "00000000000000000000000000000001",
  182409. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182410. }
  182411. },
  182412. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_I1": {
  182413. "hide_name": 0,
  182414. "bits": [ 3521, 3316, 3522 ],
  182415. "attributes": {
  182416. "force_downto": "00000000000000000000000000000001",
  182417. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182418. }
  182419. },
  182420. "cpu_I._zz_50__SB_LUT4_O_27_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  182421. "hide_name": 0,
  182422. "bits": [ 3528, 3308, 3383 ],
  182423. "attributes": {
  182424. "force_downto": "00000000000000000000000000000001",
  182425. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182426. }
  182427. },
  182428. "cpu_I._zz_50__SB_LUT4_O_28_I2": {
  182429. "hide_name": 0,
  182430. "bits": [ 3296, 3529, 3530 ],
  182431. "attributes": {
  182432. "force_downto": "00000000000000000000000000000001",
  182433. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182434. }
  182435. },
  182436. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_1_I3": {
  182437. "hide_name": 0,
  182438. "bits": [ 3533, 3308, 3534 ],
  182439. "attributes": {
  182440. "force_downto": "00000000000000000000000000000001",
  182441. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182442. }
  182443. },
  182444. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182445. "hide_name": 0,
  182446. "bits": [ 3525 ],
  182447. "attributes": {
  182448. "abc9_carry": "00000000000000000000000000000001",
  182449. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182450. }
  182451. },
  182452. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_I1": {
  182453. "hide_name": 0,
  182454. "bits": [ 3531, 3316, 3532 ],
  182455. "attributes": {
  182456. "force_downto": "00000000000000000000000000000001",
  182457. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182458. }
  182459. },
  182460. "cpu_I._zz_50__SB_LUT4_O_28_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  182461. "hide_name": 0,
  182462. "bits": [ 3538, 3308, 3383 ],
  182463. "attributes": {
  182464. "force_downto": "00000000000000000000000000000001",
  182465. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182466. }
  182467. },
  182468. "cpu_I._zz_50__SB_LUT4_O_29_I2": {
  182469. "hide_name": 0,
  182470. "bits": [ 3296, 3539, 3540 ],
  182471. "attributes": {
  182472. "force_downto": "00000000000000000000000000000001",
  182473. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182474. }
  182475. },
  182476. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_1_I3": {
  182477. "hide_name": 0,
  182478. "bits": [ 3543, 3308, 3544 ],
  182479. "attributes": {
  182480. "force_downto": "00000000000000000000000000000001",
  182481. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182482. }
  182483. },
  182484. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182485. "hide_name": 0,
  182486. "bits": [ 3535 ],
  182487. "attributes": {
  182488. "abc9_carry": "00000000000000000000000000000001",
  182489. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182490. }
  182491. },
  182492. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_I1": {
  182493. "hide_name": 0,
  182494. "bits": [ 3541, 3316, 3542 ],
  182495. "attributes": {
  182496. "force_downto": "00000000000000000000000000000001",
  182497. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182498. }
  182499. },
  182500. "cpu_I._zz_50__SB_LUT4_O_29_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  182501. "hide_name": 0,
  182502. "bits": [ 3548, 3308, 3383 ],
  182503. "attributes": {
  182504. "force_downto": "00000000000000000000000000000001",
  182505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182506. }
  182507. },
  182508. "cpu_I._zz_50__SB_LUT4_O_2_I2": {
  182509. "hide_name": 0,
  182510. "bits": [ 3427, 3428 ],
  182511. "attributes": {
  182512. "force_downto": "00000000000000000000000000000001",
  182513. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182514. }
  182515. },
  182516. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_1_I3": {
  182517. "hide_name": 0,
  182518. "bits": [ 3550, 3296, 3308, 3551 ],
  182519. "attributes": {
  182520. "force_downto": "00000000000000000000000000000001",
  182521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182522. }
  182523. },
  182524. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182525. "hide_name": 0,
  182526. "bits": [ 3554 ],
  182527. "attributes": {
  182528. "abc9_carry": "00000000000000000000000000000001",
  182529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182530. }
  182531. },
  182532. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_I2": {
  182533. "hide_name": 0,
  182534. "bits": [ 3498, 3304, 3549, 3306 ],
  182535. "attributes": {
  182536. "force_downto": "00000000000000000000000000000001",
  182537. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182538. }
  182539. },
  182540. "cpu_I._zz_50__SB_LUT4_O_2_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182541. "hide_name": 0,
  182542. "bits": [ 3555, 3316, 3296 ],
  182543. "attributes": {
  182544. "force_downto": "00000000000000000000000000000001",
  182545. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182546. }
  182547. },
  182548. "cpu_I._zz_50__SB_LUT4_O_30_I2": {
  182549. "hide_name": 0,
  182550. "bits": [ 3296, 3558, 3559 ],
  182551. "attributes": {
  182552. "force_downto": "00000000000000000000000000000001",
  182553. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182554. }
  182555. },
  182556. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_1_I3": {
  182557. "hide_name": 0,
  182558. "bits": [ 3562, 3308, 3563 ],
  182559. "attributes": {
  182560. "force_downto": "00000000000000000000000000000001",
  182561. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182562. }
  182563. },
  182564. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182565. "hide_name": 0,
  182566. "bits": [ 3545 ],
  182567. "attributes": {
  182568. "abc9_carry": "00000000000000000000000000000001",
  182569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182570. }
  182571. },
  182572. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_I1": {
  182573. "hide_name": 0,
  182574. "bits": [ 3560, 3316, 3561 ],
  182575. "attributes": {
  182576. "force_downto": "00000000000000000000000000000001",
  182577. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182578. }
  182579. },
  182580. "cpu_I._zz_50__SB_LUT4_O_30_I2_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  182581. "hide_name": 0,
  182582. "bits": [ 3564, 3308, 3383 ],
  182583. "attributes": {
  182584. "force_downto": "00000000000000000000000000000001",
  182585. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182586. }
  182587. },
  182588. "cpu_I._zz_50__SB_LUT4_O_31_I2": {
  182589. "hide_name": 0,
  182590. "bits": [ 3565, 3566 ],
  182591. "attributes": {
  182592. "force_downto": "00000000000000000000000000000001",
  182593. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182594. }
  182595. },
  182596. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_1_I1": {
  182597. "hide_name": 0,
  182598. "bits": [ 3569, 3570, 3296, 3308 ],
  182599. "attributes": {
  182600. "force_downto": "00000000000000000000000000000001",
  182601. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182602. }
  182603. },
  182604. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0": {
  182605. "hide_name": 0,
  182606. "bits": [ 3567, 3316, 3296, 3568 ],
  182607. "attributes": {
  182608. "force_downto": "00000000000000000000000000000001",
  182609. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182610. }
  182611. },
  182612. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0_SB_LUT4_O_I3": {
  182613. "hide_name": 0,
  182614. "bits": [ 3571, 3442, 3572 ],
  182615. "attributes": {
  182616. "force_downto": "00000000000000000000000000000001",
  182617. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182618. }
  182619. },
  182620. "cpu_I._zz_50__SB_LUT4_O_31_I2_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  182621. "hide_name": 0,
  182622. "bits": [ 3398, 3385, 3386, 3573 ],
  182623. "attributes": {
  182624. "force_downto": "00000000000000000000000000000001",
  182625. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182626. }
  182627. },
  182628. "cpu_I._zz_50__SB_LUT4_O_3_I2": {
  182629. "hide_name": 0,
  182630. "bits": [ 3556, 3557 ],
  182631. "attributes": {
  182632. "force_downto": "00000000000000000000000000000001",
  182633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182634. }
  182635. },
  182636. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_1_I3": {
  182637. "hide_name": 0,
  182638. "bits": [ 3575, 3296, 3308, 3576 ],
  182639. "attributes": {
  182640. "force_downto": "00000000000000000000000000000001",
  182641. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182642. }
  182643. },
  182644. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182645. "hide_name": 0,
  182646. "bits": [ 3579 ],
  182647. "attributes": {
  182648. "abc9_carry": "00000000000000000000000000000001",
  182649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182650. }
  182651. },
  182652. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_I2": {
  182653. "hide_name": 0,
  182654. "bits": [ 3485, 3304, 3574, 3306 ],
  182655. "attributes": {
  182656. "force_downto": "00000000000000000000000000000001",
  182657. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182658. }
  182659. },
  182660. "cpu_I._zz_50__SB_LUT4_O_3_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182661. "hide_name": 0,
  182662. "bits": [ 3580, 3316, 3296 ],
  182663. "attributes": {
  182664. "force_downto": "00000000000000000000000000000001",
  182665. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182666. }
  182667. },
  182668. "cpu_I._zz_50__SB_LUT4_O_4_I2": {
  182669. "hide_name": 0,
  182670. "bits": [ 3581, 3582 ],
  182671. "attributes": {
  182672. "force_downto": "00000000000000000000000000000001",
  182673. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182674. }
  182675. },
  182676. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_1_I3": {
  182677. "hide_name": 0,
  182678. "bits": [ 3584, 3296, 3308, 3585 ],
  182679. "attributes": {
  182680. "force_downto": "00000000000000000000000000000001",
  182681. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182682. }
  182683. },
  182684. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182685. "hide_name": 0,
  182686. "bits": [ 3587 ],
  182687. "attributes": {
  182688. "abc9_carry": "00000000000000000000000000000001",
  182689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182690. }
  182691. },
  182692. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_I2": {
  182693. "hide_name": 0,
  182694. "bits": [ 3471, 3304, 3583, 3306 ],
  182695. "attributes": {
  182696. "force_downto": "00000000000000000000000000000001",
  182697. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182698. }
  182699. },
  182700. "cpu_I._zz_50__SB_LUT4_O_4_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182701. "hide_name": 0,
  182702. "bits": [ 3588, 3316, 3296 ],
  182703. "attributes": {
  182704. "force_downto": "00000000000000000000000000000001",
  182705. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182706. }
  182707. },
  182708. "cpu_I._zz_50__SB_LUT4_O_5_I2": {
  182709. "hide_name": 0,
  182710. "bits": [ 3589, 3590 ],
  182711. "attributes": {
  182712. "force_downto": "00000000000000000000000000000001",
  182713. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182714. }
  182715. },
  182716. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_1_I3": {
  182717. "hide_name": 0,
  182718. "bits": [ 3592, 3296, 3308, 3593 ],
  182719. "attributes": {
  182720. "force_downto": "00000000000000000000000000000001",
  182721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182722. }
  182723. },
  182724. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182725. "hide_name": 0,
  182726. "bits": [ 3595 ],
  182727. "attributes": {
  182728. "abc9_carry": "00000000000000000000000000000001",
  182729. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182730. }
  182731. },
  182732. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_I2": {
  182733. "hide_name": 0,
  182734. "bits": [ 3458, 3304, 3591, 3306 ],
  182735. "attributes": {
  182736. "force_downto": "00000000000000000000000000000001",
  182737. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182738. }
  182739. },
  182740. "cpu_I._zz_50__SB_LUT4_O_5_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182741. "hide_name": 0,
  182742. "bits": [ 3596, 3316, 3296 ],
  182743. "attributes": {
  182744. "force_downto": "00000000000000000000000000000001",
  182745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182746. }
  182747. },
  182748. "cpu_I._zz_50__SB_LUT4_O_6_I2": {
  182749. "hide_name": 0,
  182750. "bits": [ 3597, 3598 ],
  182751. "attributes": {
  182752. "force_downto": "00000000000000000000000000000001",
  182753. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182754. }
  182755. },
  182756. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_1_I3": {
  182757. "hide_name": 0,
  182758. "bits": [ 3600, 3296, 3308, 3601 ],
  182759. "attributes": {
  182760. "force_downto": "00000000000000000000000000000001",
  182761. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182762. }
  182763. },
  182764. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182765. "hide_name": 0,
  182766. "bits": [ 3603 ],
  182767. "attributes": {
  182768. "abc9_carry": "00000000000000000000000000000001",
  182769. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182770. }
  182771. },
  182772. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_I2": {
  182773. "hide_name": 0,
  182774. "bits": [ 3446, 3304, 3599, 3306 ],
  182775. "attributes": {
  182776. "force_downto": "00000000000000000000000000000001",
  182777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182778. }
  182779. },
  182780. "cpu_I._zz_50__SB_LUT4_O_6_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182781. "hide_name": 0,
  182782. "bits": [ 3604, 3316, 3296 ],
  182783. "attributes": {
  182784. "force_downto": "00000000000000000000000000000001",
  182785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182786. }
  182787. },
  182788. "cpu_I._zz_50__SB_LUT4_O_7_I2": {
  182789. "hide_name": 0,
  182790. "bits": [ 3605, 3606 ],
  182791. "attributes": {
  182792. "force_downto": "00000000000000000000000000000001",
  182793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182794. }
  182795. },
  182796. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_1_I3": {
  182797. "hide_name": 0,
  182798. "bits": [ 3609, 3296, 3308, 3610 ],
  182799. "attributes": {
  182800. "force_downto": "00000000000000000000000000000001",
  182801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182802. }
  182803. },
  182804. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182805. "hide_name": 0,
  182806. "bits": [ 3612 ],
  182807. "attributes": {
  182808. "abc9_carry": "00000000000000000000000000000001",
  182809. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182810. }
  182811. },
  182812. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_I2": {
  182813. "hide_name": 0,
  182814. "bits": [ 3607, 3304, 3608, 3306 ],
  182815. "attributes": {
  182816. "force_downto": "00000000000000000000000000000001",
  182817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182818. }
  182819. },
  182820. "cpu_I._zz_50__SB_LUT4_O_7_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182821. "hide_name": 0,
  182822. "bits": [ 3613, 3316, 3296 ],
  182823. "attributes": {
  182824. "force_downto": "00000000000000000000000000000001",
  182825. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182826. }
  182827. },
  182828. "cpu_I._zz_50__SB_LUT4_O_8_I2": {
  182829. "hide_name": 0,
  182830. "bits": [ 3614, 3615 ],
  182831. "attributes": {
  182832. "force_downto": "00000000000000000000000000000001",
  182833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182834. }
  182835. },
  182836. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3": {
  182837. "hide_name": 0,
  182838. "bits": [ 3618, 3296, 3308, 3619 ],
  182839. "attributes": {
  182840. "force_downto": "00000000000000000000000000000001",
  182841. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182842. }
  182843. },
  182844. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182845. "hide_name": 0,
  182846. "bits": [ 3621 ],
  182847. "attributes": {
  182848. "abc9_carry": "00000000000000000000000000000001",
  182849. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182850. }
  182851. },
  182852. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_I2": {
  182853. "hide_name": 0,
  182854. "bits": [ 3616, 3304, 3617, 3306 ],
  182855. "attributes": {
  182856. "force_downto": "00000000000000000000000000000001",
  182857. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182858. }
  182859. },
  182860. "cpu_I._zz_50__SB_LUT4_O_8_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182861. "hide_name": 0,
  182862. "bits": [ 3622, 3316, 3296 ],
  182863. "attributes": {
  182864. "force_downto": "00000000000000000000000000000001",
  182865. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182866. }
  182867. },
  182868. "cpu_I._zz_50__SB_LUT4_O_9_I2": {
  182869. "hide_name": 0,
  182870. "bits": [ 3623, 3624 ],
  182871. "attributes": {
  182872. "force_downto": "00000000000000000000000000000001",
  182873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182874. }
  182875. },
  182876. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3": {
  182877. "hide_name": 0,
  182878. "bits": [ 3626, 3296, 3308, 3627 ],
  182879. "attributes": {
  182880. "force_downto": "00000000000000000000000000000001",
  182881. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182882. }
  182883. },
  182884. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  182885. "hide_name": 0,
  182886. "bits": [ 3313 ],
  182887. "attributes": {
  182888. "abc9_carry": "00000000000000000000000000000001",
  182889. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182890. }
  182891. },
  182892. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_I2": {
  182893. "hide_name": 0,
  182894. "bits": [ 3397, 3304, 3625, 3306 ],
  182895. "attributes": {
  182896. "force_downto": "00000000000000000000000000000001",
  182897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182898. }
  182899. },
  182900. "cpu_I._zz_50__SB_LUT4_O_9_I2_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182901. "hide_name": 0,
  182902. "bits": [ 3628, 3316, 3296 ],
  182903. "attributes": {
  182904. "force_downto": "00000000000000000000000000000001",
  182905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182906. }
  182907. },
  182908. "cpu_I._zz_50__SB_LUT4_O_I2": {
  182909. "hide_name": 0,
  182910. "bits": [ 3296, 3297, 3298 ],
  182911. "attributes": {
  182912. "force_downto": "00000000000000000000000000000001",
  182913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182914. }
  182915. },
  182916. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_1_I2": {
  182917. "hide_name": 0,
  182918. "bits": [ 3631, 3632, 3308 ],
  182919. "attributes": {
  182920. "force_downto": "00000000000000000000000000000001",
  182921. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182922. }
  182923. },
  182924. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  182925. "hide_name": 0,
  182926. "bits": [ 3410 ],
  182927. "attributes": {
  182928. "abc9_carry": "00000000000000000000000000000001",
  182929. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4097.40-4097.77|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  182930. }
  182931. },
  182932. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1": {
  182933. "hide_name": 0,
  182934. "bits": [ 3629, 3316, 3630 ],
  182935. "attributes": {
  182936. "force_downto": "00000000000000000000000000000001",
  182937. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182938. }
  182939. },
  182940. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2": {
  182941. "hide_name": 0,
  182942. "bits": [ 3635, 3442, 3636 ],
  182943. "attributes": {
  182944. "force_downto": "00000000000000000000000000000001",
  182945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182946. }
  182947. },
  182948. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_I2_O": {
  182949. "hide_name": 0,
  182950. "bits": [ 3401, 3316, 3308, 3404 ],
  182951. "attributes": {
  182952. "force_downto": "00000000000000000000000000000001",
  182953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182954. }
  182955. },
  182956. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I2_SB_LUT4_O_1_I3": {
  182957. "hide_name": 0,
  182958. "bits": [ 3616, 3385, 3386, 3637 ],
  182959. "attributes": {
  182960. "force_downto": "00000000000000000000000000000001",
  182961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182962. }
  182963. },
  182964. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I3": {
  182965. "hide_name": 0,
  182966. "bits": [ 3633, 3442, 3634 ],
  182967. "attributes": {
  182968. "force_downto": "00000000000000000000000000000001",
  182969. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182970. }
  182971. },
  182972. "cpu_I._zz_50__SB_LUT4_O_I2_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  182973. "hide_name": 0,
  182974. "bits": [ 3518, 3385, 3386, 3638 ],
  182975. "attributes": {
  182976. "force_downto": "00000000000000000000000000000001",
  182977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  182978. }
  182979. },
  182980. "cpu_I._zz_51_": {
  182981. "hide_name": 0,
  182982. "bits": [ 1378 ],
  182983. "attributes": {
  182984. "hdlname": "cpu_I _zz_51_",
  182985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:845.23-845.30"
  182986. }
  182987. },
  182988. "cpu_I._zz_51__0": {
  182989. "hide_name": 0,
  182990. "bits": [ "0" ],
  182991. "attributes": {
  182992. "hdlname": "cpu_I _zz_51__0",
  182993. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:846.23-846.32"
  182994. }
  182995. },
  182996. "cpu_I._zz_52_": {
  182997. "hide_name": 0,
  182998. "bits": [ 1822, 1823 ],
  182999. "attributes": {
  183000. "hdlname": "cpu_I _zz_52_",
  183001. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:848.20-848.27"
  183002. }
  183003. },
  183004. "cpu_I._zz_55_": {
  183005. "hide_name": 0,
  183006. "bits": [ 7108, "0", 7109, 7110 ],
  183007. "attributes": {
  183008. "hdlname": "cpu_I _zz_55_",
  183009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:964.23-964.30",
  183010. "unused_bits": "0 2 3"
  183011. }
  183012. },
  183013. "cpu_I._zz_56_": {
  183014. "hide_name": 0,
  183015. "bits": [ "x", "0", 7111, 7112 ],
  183016. "attributes": {
  183017. "hdlname": "cpu_I _zz_56_",
  183018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:965.23-965.30",
  183019. "unused_bits": "2 3"
  183020. }
  183021. },
  183022. "cpu_I._zz_5_": {
  183023. "hide_name": 0,
  183024. "bits": [ 2857, 2856 ],
  183025. "attributes": {
  183026. "hdlname": "cpu_I _zz_5_",
  183027. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:684.20-684.26"
  183028. }
  183029. },
  183030. "cpu_I._zz_61_": {
  183031. "hide_name": 0,
  183032. "bits": [ "1" ],
  183033. "attributes": {
  183034. "hdlname": "cpu_I _zz_61_",
  183035. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1006.23-1006.30"
  183036. }
  183037. },
  183038. "cpu_I._zz_63_": {
  183039. "hide_name": 0,
  183040. "bits": [ 1472 ],
  183041. "attributes": {
  183042. "hdlname": "cpu_I _zz_63_",
  183043. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1009.23-1009.30"
  183044. }
  183045. },
  183046. "cpu_I._zz_68_": {
  183047. "hide_name": 0,
  183048. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  183049. "attributes": {
  183050. "hdlname": "cpu_I _zz_68_",
  183051. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1014.23-1014.30"
  183052. }
  183053. },
  183054. "cpu_I._zz_69_": {
  183055. "hide_name": 0,
  183056. "bits": [ 1821 ],
  183057. "attributes": {
  183058. "hdlname": "cpu_I _zz_69_",
  183059. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1027.23-1027.30"
  183060. }
  183061. },
  183062. "cpu_I._zz_6_": {
  183063. "hide_name": 0,
  183064. "bits": [ 2857, 2856 ],
  183065. "attributes": {
  183066. "hdlname": "cpu_I _zz_6_",
  183067. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:685.20-685.26"
  183068. }
  183069. },
  183070. "cpu_I._zz_70_": {
  183071. "hide_name": 0,
  183072. "bits": [ 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  183073. "attributes": {
  183074. "hdlname": "cpu_I _zz_70_",
  183075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1028.23-1028.30"
  183076. }
  183077. },
  183078. "cpu_I._zz_71_": {
  183079. "hide_name": 0,
  183080. "bits": [ 1821 ],
  183081. "attributes": {
  183082. "hdlname": "cpu_I _zz_71_",
  183083. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1029.23-1029.30"
  183084. }
  183085. },
  183086. "cpu_I._zz_72_": {
  183087. "hide_name": 0,
  183088. "bits": [ 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  183089. "attributes": {
  183090. "hdlname": "cpu_I _zz_72_",
  183091. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1030.23-1030.30"
  183092. }
  183093. },
  183094. "cpu_I._zz_73_": {
  183095. "hide_name": 0,
  183096. "bits": [ 1821 ],
  183097. "attributes": {
  183098. "hdlname": "cpu_I _zz_73_",
  183099. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1031.23-1031.30"
  183100. }
  183101. },
  183102. "cpu_I._zz_74_": {
  183103. "hide_name": 0,
  183104. "bits": [ 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  183105. "attributes": {
  183106. "hdlname": "cpu_I _zz_74_",
  183107. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1032.23-1032.30"
  183108. }
  183109. },
  183110. "cpu_I._zz_75_": {
  183111. "hide_name": 0,
  183112. "bits": [ 1824 ],
  183113. "attributes": {
  183114. "hdlname": "cpu_I _zz_75_",
  183115. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1033.23-1033.30"
  183116. }
  183117. },
  183118. "cpu_I._zz_75__SB_LUT4_O_I3": {
  183119. "hide_name": 0,
  183120. "bits": [ 1552, 1542, 1994 ],
  183121. "attributes": {
  183122. "force_downto": "00000000000000000000000000000001",
  183123. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183124. }
  183125. },
  183126. "cpu_I._zz_76_": {
  183127. "hide_name": 0,
  183128. "bits": [ 1821 ],
  183129. "attributes": {
  183130. "hdlname": "cpu_I _zz_76_",
  183131. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1034.23-1034.30"
  183132. }
  183133. },
  183134. "cpu_I._zz_77_": {
  183135. "hide_name": 0,
  183136. "bits": [ 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  183137. "attributes": {
  183138. "hdlname": "cpu_I _zz_77_",
  183139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1035.23-1035.30"
  183140. }
  183141. },
  183142. "cpu_I._zz_78_": {
  183143. "hide_name": 0,
  183144. "bits": [ 1821 ],
  183145. "attributes": {
  183146. "hdlname": "cpu_I _zz_78_",
  183147. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1036.23-1036.30"
  183148. }
  183149. },
  183150. "cpu_I._zz_79_": {
  183151. "hide_name": 0,
  183152. "bits": [ 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821, 1821 ],
  183153. "attributes": {
  183154. "hdlname": "cpu_I _zz_79_",
  183155. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1037.23-1037.30"
  183156. }
  183157. },
  183158. "cpu_I._zz_7_": {
  183159. "hide_name": 0,
  183160. "bits": [ 4907, 4906 ],
  183161. "attributes": {
  183162. "hdlname": "cpu_I _zz_7_",
  183163. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:689.20-689.26"
  183164. }
  183165. },
  183166. "cpu_I._zz_81_": {
  183167. "hide_name": 0,
  183168. "bits": [ "0" ],
  183169. "attributes": {
  183170. "hdlname": "cpu_I _zz_81_",
  183171. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1062.23-1062.30"
  183172. }
  183173. },
  183174. "cpu_I._zz_82_": {
  183175. "hide_name": 0,
  183176. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3640, 3642, 3671, 3679, 3680, 3681, 3682, 3683, 3678, 3677, 3675, 3673, 3670, 3669, 3667, 3665, 3686, 3688, 3645, 3649, 3652, 3656, 3660, 3663 ],
  183177. "attributes": {
  183178. "hdlname": "cpu_I _zz_82_",
  183179. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1064.23-1064.30"
  183180. }
  183181. },
  183182. "cpu_I._zz_82__SB_LUT4_O_10_I3": {
  183183. "hide_name": 0,
  183184. "bits": [ 3643, 964, 3644 ],
  183185. "attributes": {
  183186. "force_downto": "00000000000000000000000000000001",
  183187. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183188. }
  183189. },
  183190. "cpu_I._zz_82__SB_LUT4_O_11_I3": {
  183191. "hide_name": 0,
  183192. "bits": [ 3647, 964, 3648 ],
  183193. "attributes": {
  183194. "force_downto": "00000000000000000000000000000001",
  183195. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183196. }
  183197. },
  183198. "cpu_I._zz_82__SB_LUT4_O_12_I3": {
  183199. "hide_name": 0,
  183200. "bits": [ 2996, 964, 3651 ],
  183201. "attributes": {
  183202. "force_downto": "00000000000000000000000000000001",
  183203. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183204. }
  183205. },
  183206. "cpu_I._zz_82__SB_LUT4_O_13_I3": {
  183207. "hide_name": 0,
  183208. "bits": [ 3654, 964, 3655 ],
  183209. "attributes": {
  183210. "force_downto": "00000000000000000000000000000001",
  183211. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183212. }
  183213. },
  183214. "cpu_I._zz_82__SB_LUT4_O_14_I3": {
  183215. "hide_name": 0,
  183216. "bits": [ 3658, 964, 3659 ],
  183217. "attributes": {
  183218. "force_downto": "00000000000000000000000000000001",
  183219. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183220. }
  183221. },
  183222. "cpu_I._zz_82__SB_LUT4_O_15_I3": {
  183223. "hide_name": 0,
  183224. "bits": [ 3661, 964, 3662 ],
  183225. "attributes": {
  183226. "force_downto": "00000000000000000000000000000001",
  183227. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183228. }
  183229. },
  183230. "cpu_I._zz_82__SB_LUT4_O_8_I3": {
  183231. "hide_name": 0,
  183232. "bits": [ 3684, 964, 3685 ],
  183233. "attributes": {
  183234. "force_downto": "00000000000000000000000000000001",
  183235. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183236. }
  183237. },
  183238. "cpu_I._zz_82__SB_LUT4_O_9_I3": {
  183239. "hide_name": 0,
  183240. "bits": [ 3016, 964, 3687 ],
  183241. "attributes": {
  183242. "force_downto": "00000000000000000000000000000001",
  183243. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183244. }
  183245. },
  183246. "cpu_I._zz_88_": {
  183247. "hide_name": 0,
  183248. "bits": [ 2331, 2330, 2591, 3294, 3291, 2339, 3276, 3289, 3288, 1362, 7113, 3287, 3286, 2337, 7114, 2333, 2327, 2341, 7115, 7116, 2340, 3966, 2588, 2857, 2856, 2590, 1822, 1823, "x", 2329, 2327 ],
  183249. "attributes": {
  183250. "hdlname": "cpu_I _zz_88_",
  183251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1073.23-1073.30",
  183252. "unused_bits": "10 14 18 19"
  183253. }
  183254. },
  183255. "cpu_I._zz_89_": {
  183256. "hide_name": 0,
  183257. "bits": [ 2328 ],
  183258. "attributes": {
  183259. "hdlname": "cpu_I _zz_89_",
  183260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1074.23-1074.30"
  183261. }
  183262. },
  183263. "cpu_I._zz_8_": {
  183264. "hide_name": 0,
  183265. "bits": [ 4907, 4906 ],
  183266. "attributes": {
  183267. "hdlname": "cpu_I _zz_8_",
  183268. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:690.20-690.26"
  183269. }
  183270. },
  183271. "cpu_I._zz_90_": {
  183272. "hide_name": 0,
  183273. "bits": [ 3276 ],
  183274. "attributes": {
  183275. "hdlname": "cpu_I _zz_90_",
  183276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1075.23-1075.30"
  183277. }
  183278. },
  183279. "cpu_I._zz_91_": {
  183280. "hide_name": 0,
  183281. "bits": [ 2327 ],
  183282. "attributes": {
  183283. "hdlname": "cpu_I _zz_91_",
  183284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1076.23-1076.30"
  183285. }
  183286. },
  183287. "cpu_I._zz_94_": {
  183288. "hide_name": 0,
  183289. "bits": [ 2331, 2330 ],
  183290. "attributes": {
  183291. "hdlname": "cpu_I _zz_94_",
  183292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1079.20-1079.27"
  183293. }
  183294. },
  183295. "cpu_I._zz_95_": {
  183296. "hide_name": 0,
  183297. "bits": [ 3294, 3291 ],
  183298. "attributes": {
  183299. "hdlname": "cpu_I _zz_95_",
  183300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1080.20-1080.27"
  183301. }
  183302. },
  183303. "cpu_I._zz_96_": {
  183304. "hide_name": 0,
  183305. "bits": [ 3276, 3289 ],
  183306. "attributes": {
  183307. "hdlname": "cpu_I _zz_96_",
  183308. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1081.20-1081.27"
  183309. }
  183310. },
  183311. "cpu_I._zz_97_": {
  183312. "hide_name": 0,
  183313. "bits": [ 3288, 1362 ],
  183314. "attributes": {
  183315. "hdlname": "cpu_I _zz_97_",
  183316. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1082.20-1082.27"
  183317. }
  183318. },
  183319. "cpu_I._zz_98_": {
  183320. "hide_name": 0,
  183321. "bits": [ 3287, 3286 ],
  183322. "attributes": {
  183323. "hdlname": "cpu_I _zz_98_",
  183324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1083.20-1083.27"
  183325. }
  183326. },
  183327. "cpu_I._zz_99_": {
  183328. "hide_name": 0,
  183329. "bits": [ 2857, 2856 ],
  183330. "attributes": {
  183331. "hdlname": "cpu_I _zz_99_",
  183332. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1084.20-1084.27"
  183333. }
  183334. },
  183335. "cpu_I._zz_9_": {
  183336. "hide_name": 0,
  183337. "bits": [ 1240, 1239 ],
  183338. "attributes": {
  183339. "hdlname": "cpu_I _zz_9_",
  183340. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:691.20-691.26"
  183341. }
  183342. },
  183343. "cpu_I.clk": {
  183344. "hide_name": 0,
  183345. "bits": [ 42 ],
  183346. "attributes": {
  183347. "hdlname": "cpu_I clk",
  183348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:364.23-364.26"
  183349. }
  183350. },
  183351. "cpu_I.dBusWishbone_ADR": {
  183352. "hide_name": 0,
  183353. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730, 687, 689, 894, 893, "x", "x", 736, 735 ],
  183354. "attributes": {
  183355. "hdlname": "cpu_I dBusWishbone_ADR",
  183356. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:357.23-357.39"
  183357. }
  183358. },
  183359. "cpu_I.dBusWishbone_BTE": {
  183360. "hide_name": 0,
  183361. "bits": [ "0", "0" ],
  183362. "attributes": {
  183363. "hdlname": "cpu_I dBusWishbone_BTE",
  183364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:362.23-362.39"
  183365. }
  183366. },
  183367. "cpu_I.dBusWishbone_CTI": {
  183368. "hide_name": 0,
  183369. "bits": [ "0", "0", "0" ],
  183370. "attributes": {
  183371. "hdlname": "cpu_I dBusWishbone_CTI",
  183372. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:363.23-363.39"
  183373. }
  183374. },
  183375. "cpu_I.dBusWishbone_DAT_MISO": {
  183376. "hide_name": 0,
  183377. "bits": [ 822, 786, 840, 831, 828, 825, 816, 783, 750, 747, 819, 813, 810, 807, 804, 801, 798, 795, 792, 789, 780, 777, 774, 771, 768, 765, 762, 759, 756, 753, 837, 834 ],
  183378. "attributes": {
  183379. "hdlname": "cpu_I dBusWishbone_DAT_MISO",
  183380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:358.23-358.44"
  183381. }
  183382. },
  183383. "cpu_I.dBusWishbone_DAT_MOSI": {
  183384. "hide_name": 0,
  183385. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  183386. "attributes": {
  183387. "hdlname": "cpu_I dBusWishbone_DAT_MOSI",
  183388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:359.23-359.44"
  183389. }
  183390. },
  183391. "cpu_I.dBusWishbone_ERR": {
  183392. "hide_name": 0,
  183393. "bits": [ "0" ],
  183394. "attributes": {
  183395. "hdlname": "cpu_I dBusWishbone_ERR",
  183396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:361.23-361.39"
  183397. }
  183398. },
  183399. "cpu_I.dBusWishbone_WE": {
  183400. "hide_name": 0,
  183401. "bits": [ 469 ],
  183402. "attributes": {
  183403. "hdlname": "cpu_I dBusWishbone_WE",
  183404. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:356.23-356.38"
  183405. }
  183406. },
  183407. "cpu_I.dBus_cmd_halfPipe_payload_address": {
  183408. "hide_name": 0,
  183409. "bits": [ 3698, 3697, 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730, 687, 689, 894, 893, "x", "x", 736, 735 ],
  183410. "attributes": {
  183411. "hdlname": "cpu_I dBus_cmd_halfPipe_payload_address",
  183412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1331.23-1331.56"
  183413. }
  183414. },
  183415. "cpu_I.dBus_cmd_halfPipe_payload_data": {
  183416. "hide_name": 0,
  183417. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  183418. "attributes": {
  183419. "hdlname": "cpu_I dBus_cmd_halfPipe_payload_data",
  183420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1332.23-1332.53"
  183421. }
  183422. },
  183423. "cpu_I.dBus_cmd_halfPipe_payload_size": {
  183424. "hide_name": 0,
  183425. "bits": [ 3705, 3704 ],
  183426. "attributes": {
  183427. "hdlname": "cpu_I dBus_cmd_halfPipe_payload_size",
  183428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1333.23-1333.53"
  183429. }
  183430. },
  183431. "cpu_I.dBus_cmd_halfPipe_payload_wr": {
  183432. "hide_name": 0,
  183433. "bits": [ 469 ],
  183434. "attributes": {
  183435. "hdlname": "cpu_I dBus_cmd_halfPipe_payload_wr",
  183436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1330.23-1330.51"
  183437. }
  183438. },
  183439. "cpu_I.dBus_cmd_halfPipe_regs_payload_address": {
  183440. "hide_name": 0,
  183441. "bits": [ 3698, 3697, 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730, 687, 689, 894, 893, "x", "x", 736, 735 ],
  183442. "attributes": {
  183443. "hdlname": "cpu_I dBus_cmd_halfPipe_regs_payload_address",
  183444. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1337.23-1337.61"
  183445. }
  183446. },
  183447. "cpu_I.dBus_cmd_halfPipe_regs_payload_data": {
  183448. "hide_name": 0,
  183449. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  183450. "attributes": {
  183451. "hdlname": "cpu_I dBus_cmd_halfPipe_regs_payload_data",
  183452. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1338.23-1338.58"
  183453. }
  183454. },
  183455. "cpu_I.dBus_cmd_halfPipe_regs_payload_size": {
  183456. "hide_name": 0,
  183457. "bits": [ 3705, 3704 ],
  183458. "attributes": {
  183459. "hdlname": "cpu_I dBus_cmd_halfPipe_regs_payload_size",
  183460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1339.23-1339.58"
  183461. }
  183462. },
  183463. "cpu_I.dBus_cmd_halfPipe_regs_payload_wr": {
  183464. "hide_name": 0,
  183465. "bits": [ 469 ],
  183466. "attributes": {
  183467. "hdlname": "cpu_I dBus_cmd_halfPipe_regs_payload_wr",
  183468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1336.23-1336.56"
  183469. }
  183470. },
  183471. "cpu_I.dBus_cmd_payload_address": {
  183472. "hide_name": 0,
  183473. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  183474. "attributes": {
  183475. "hdlname": "cpu_I dBus_cmd_payload_address",
  183476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1056.23-1056.47",
  183477. "unused_bits": "28 29"
  183478. }
  183479. },
  183480. "cpu_I.dBus_cmd_payload_data": {
  183481. "hide_name": 0,
  183482. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3640, 3642, 3671, 3679, 3680, 3681, 3682, 3683, 3678, 3677, 3675, 3673, 3670, 3669, 3667, 3665, 3686, 3688, 3645, 3649, 3652, 3656, 3660, 3663 ],
  183483. "attributes": {
  183484. "hdlname": "cpu_I dBus_cmd_payload_data",
  183485. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1057.23-1057.44"
  183486. }
  183487. },
  183488. "cpu_I.dBus_cmd_payload_size": {
  183489. "hide_name": 0,
  183490. "bits": [ 966, 964 ],
  183491. "attributes": {
  183492. "hdlname": "cpu_I dBus_cmd_payload_size",
  183493. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1058.23-1058.44"
  183494. }
  183495. },
  183496. "cpu_I.dBus_cmd_payload_wr": {
  183497. "hide_name": 0,
  183498. "bits": [ 982 ],
  183499. "attributes": {
  183500. "hdlname": "cpu_I dBus_cmd_payload_wr",
  183501. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1055.23-1055.42"
  183502. }
  183503. },
  183504. "cpu_I.dBus_rsp_data": {
  183505. "hide_name": 0,
  183506. "bits": [ 822, 786, 840, 831, 828, 825, 816, 783, 750, 747, 819, 813, 810, 807, 804, 801, 798, 795, 792, 789, 780, 777, 774, 771, 768, 765, 762, 759, 756, 753, 837, 834 ],
  183507. "attributes": {
  183508. "hdlname": "cpu_I dBus_rsp_data",
  183509. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1061.23-1061.36"
  183510. }
  183511. },
  183512. "cpu_I.dBus_rsp_error": {
  183513. "hide_name": 0,
  183514. "bits": [ "0" ],
  183515. "attributes": {
  183516. "hdlname": "cpu_I dBus_rsp_error",
  183517. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1060.23-1060.37"
  183518. }
  183519. },
  183520. "cpu_I.decode_ALU_BITWISE_CTRL": {
  183521. "hide_name": 0,
  183522. "bits": [ 3288, 1362 ],
  183523. "attributes": {
  183524. "hdlname": "cpu_I decode_ALU_BITWISE_CTRL",
  183525. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:711.20-711.43"
  183526. }
  183527. },
  183528. "cpu_I.decode_ALU_CTRL": {
  183529. "hide_name": 0,
  183530. "bits": [ 3276, 3289 ],
  183531. "attributes": {
  183532. "hdlname": "cpu_I decode_ALU_CTRL",
  183533. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:703.20-703.35"
  183534. }
  183535. },
  183536. "cpu_I.decode_BRANCH_CTRL": {
  183537. "hide_name": 0,
  183538. "bits": [ 1822, 1823 ],
  183539. "attributes": {
  183540. "hdlname": "cpu_I decode_BRANCH_CTRL",
  183541. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:847.20-847.38"
  183542. }
  183543. },
  183544. "cpu_I.decode_BYPASSABLE_EXECUTE_STAGE": {
  183545. "hide_name": 0,
  183546. "bits": [ 2333 ],
  183547. "attributes": {
  183548. "hdlname": "cpu_I decode_BYPASSABLE_EXECUTE_STAGE",
  183549. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:688.23-688.54"
  183550. }
  183551. },
  183552. "cpu_I.decode_BYPASSABLE_MEMORY_STAGE": {
  183553. "hide_name": 0,
  183554. "bits": [ 2339 ],
  183555. "attributes": {
  183556. "hdlname": "cpu_I decode_BYPASSABLE_MEMORY_STAGE",
  183557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:702.23-702.53"
  183558. }
  183559. },
  183560. "cpu_I.decode_CSR_WRITE_OPCODE": {
  183561. "hide_name": 0,
  183562. "bits": [ 3707 ],
  183563. "attributes": {
  183564. "hdlname": "cpu_I decode_CSR_WRITE_OPCODE",
  183565. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:708.23-708.46"
  183566. }
  183567. },
  183568. "cpu_I.decode_CSR_WRITE_OPCODE_SB_LUT4_O_I3": {
  183569. "hide_name": 0,
  183570. "bits": [ 1535, 1537, 3706 ],
  183571. "attributes": {
  183572. "force_downto": "00000000000000000000000000000001",
  183573. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183574. }
  183575. },
  183576. "cpu_I.decode_ENV_CTRL": {
  183577. "hide_name": 0,
  183578. "bits": [ 3287, 3286 ],
  183579. "attributes": {
  183580. "hdlname": "cpu_I decode_ENV_CTRL",
  183581. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:693.20-693.35"
  183582. }
  183583. },
  183584. "cpu_I.decode_INSTRUCTION": {
  183585. "hide_name": 0,
  183586. "bits": [ 1545, 1544, 2328, 1364, 1543, 2329, 1363, 2853, 1542, 1541, 1539, 1538, 1362, 1537, 1536, 1535, 1534, 1533, 1532, 1531, 1530, 1552, 1551, 1550, 1549, 1548, 1547, 1546, 1540, 1529, 1528, 1821 ],
  183587. "attributes": {
  183588. "hdlname": "cpu_I decode_INSTRUCTION",
  183589. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:849.23-849.41"
  183590. }
  183591. },
  183592. "cpu_I.decode_INSTRUCTION_ANTICIPATED": {
  183593. "hide_name": 0,
  183594. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 7117, 7118, 7119, 7120, 7121, 7122, 7123, 7124, 7125, 7126, "x", "x", "x", "x", "x", "x", "x" ],
  183595. "attributes": {
  183596. "hdlname": "cpu_I decode_INSTRUCTION_ANTICIPATED",
  183597. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:803.23-803.53",
  183598. "unused_bits": "15 16 17 18 19 20 21 22 23 24"
  183599. }
  183600. },
  183601. "cpu_I.decode_IS_CSR": {
  183602. "hide_name": 0,
  183603. "bits": [ 2337 ],
  183604. "attributes": {
  183605. "hdlname": "cpu_I decode_IS_CSR",
  183606. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:698.23-698.36"
  183607. }
  183608. },
  183609. "cpu_I.decode_IS_DIV": {
  183610. "hide_name": 0,
  183611. "bits": [ 2341 ],
  183612. "attributes": {
  183613. "hdlname": "cpu_I decode_IS_DIV",
  183614. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:710.23-710.36"
  183615. }
  183616. },
  183617. "cpu_I.decode_IS_MUL": {
  183618. "hide_name": 0,
  183619. "bits": [ 2588 ],
  183620. "attributes": {
  183621. "hdlname": "cpu_I decode_IS_MUL",
  183622. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:733.23-733.36"
  183623. }
  183624. },
  183625. "cpu_I.decode_IS_RS1_SIGNED": {
  183626. "hide_name": 0,
  183627. "bits": [ 2327 ],
  183628. "attributes": {
  183629. "hdlname": "cpu_I decode_IS_RS1_SIGNED",
  183630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:679.23-679.43"
  183631. }
  183632. },
  183633. "cpu_I.decode_IS_RS2_SIGNED": {
  183634. "hide_name": 0,
  183635. "bits": [ 2327 ],
  183636. "attributes": {
  183637. "hdlname": "cpu_I decode_IS_RS2_SIGNED",
  183638. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:678.23-678.43"
  183639. }
  183640. },
  183641. "cpu_I.decode_MEMORY_ENABLE": {
  183642. "hide_name": 0,
  183643. "bits": [ 2591 ],
  183644. "attributes": {
  183645. "hdlname": "cpu_I decode_MEMORY_ENABLE",
  183646. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:843.23-843.43"
  183647. }
  183648. },
  183649. "cpu_I.decode_MEMORY_STORE": {
  183650. "hide_name": 0,
  183651. "bits": [ 2329 ],
  183652. "attributes": {
  183653. "hdlname": "cpu_I decode_MEMORY_STORE",
  183654. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:734.23-734.42"
  183655. }
  183656. },
  183657. "cpu_I.decode_PC": {
  183658. "hide_name": 0,
  183659. "bits": [ "0", "0", 1461, 1457, 1446, 1422, 1414, 1404, 1394, 1377, 1432, 1509, 1505, 1503, 1501, 1499, 1497, 1495, 1493, 1491, 1489, 1487, 1523, 1521, 1519, 1517, 1515, 1513, 1511, 1507, 1485, 1483 ],
  183660. "attributes": {
  183661. "hdlname": "cpu_I decode_PC",
  183662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:852.23-852.32"
  183663. }
  183664. },
  183665. "cpu_I.decode_PREDICTION_HAD_BRANCHED2": {
  183666. "hide_name": 0,
  183667. "bits": [ 1815 ],
  183668. "attributes": {
  183669. "hdlname": "cpu_I decode_PREDICTION_HAD_BRANCHED2",
  183670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:735.23-735.54"
  183671. }
  183672. },
  183673. "cpu_I.decode_RS1": {
  183674. "hide_name": 0,
  183675. "bits": [ 3710, 3761, 3714, 3827, 3822, 3817, 3812, 3799, 3754, 3712, 3806, 3801, 3795, 3790, 3785, 3782, 3777, 3774, 3771, 3766, 3756, 3748, 3743, 3738, 3735, 3732, 3729, 3726, 3723, 3720, 3837, 3832 ],
  183676. "attributes": {
  183677. "hdlname": "cpu_I decode_RS1",
  183678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:775.23-775.33"
  183679. }
  183680. },
  183681. "cpu_I.decode_RS1_SB_LUT4_O_10_I3": {
  183682. "hide_name": 0,
  183683. "bits": [ 3708, 2861, 3713 ],
  183684. "attributes": {
  183685. "force_downto": "00000000000000000000000000000001",
  183686. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183687. }
  183688. },
  183689. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O_I3": {
  183690. "hide_name": 0,
  183691. "bits": [ 3715, 3196, 3716 ],
  183692. "attributes": {
  183693. "force_downto": "00000000000000000000000000000001",
  183694. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183695. }
  183696. },
  183697. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  183698. "hide_name": 0,
  183699. "bits": [ 2323, 3717, 2291 ],
  183700. "attributes": {
  183701. "force_downto": "00000000000000000000000000000001",
  183702. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183703. }
  183704. },
  183705. "cpu_I.decode_RS1_SB_LUT4_O_10_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  183706. "hide_name": 0,
  183707. "bits": [ 2063, 3718, 2094 ],
  183708. "attributes": {
  183709. "force_downto": "00000000000000000000000000000001",
  183710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183711. }
  183712. },
  183713. "cpu_I.decode_RS1_SB_LUT4_O_11_I2": {
  183714. "hide_name": 0,
  183715. "bits": [ 3708, 3719, 2980 ],
  183716. "attributes": {
  183717. "force_downto": "00000000000000000000000000000001",
  183718. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183719. }
  183720. },
  183721. "cpu_I.decode_RS1_SB_LUT4_O_11_I2_SB_LUT4_O_I3": {
  183722. "hide_name": 0,
  183723. "bits": [ 3715, 3203, 3721 ],
  183724. "attributes": {
  183725. "force_downto": "00000000000000000000000000000001",
  183726. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183727. }
  183728. },
  183729. "cpu_I.decode_RS1_SB_LUT4_O_12_I2": {
  183730. "hide_name": 0,
  183731. "bits": [ 3708, 3722, 2984 ],
  183732. "attributes": {
  183733. "force_downto": "00000000000000000000000000000001",
  183734. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183735. }
  183736. },
  183737. "cpu_I.decode_RS1_SB_LUT4_O_12_I2_SB_LUT4_O_I3": {
  183738. "hide_name": 0,
  183739. "bits": [ 3715, 3208, 3724 ],
  183740. "attributes": {
  183741. "force_downto": "00000000000000000000000000000001",
  183742. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183743. }
  183744. },
  183745. "cpu_I.decode_RS1_SB_LUT4_O_13_I2": {
  183746. "hide_name": 0,
  183747. "bits": [ 3708, 3725, 2966 ],
  183748. "attributes": {
  183749. "force_downto": "00000000000000000000000000000001",
  183750. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183751. }
  183752. },
  183753. "cpu_I.decode_RS1_SB_LUT4_O_13_I2_SB_LUT4_O_I3": {
  183754. "hide_name": 0,
  183755. "bits": [ 3715, 3167, 3727 ],
  183756. "attributes": {
  183757. "force_downto": "00000000000000000000000000000001",
  183758. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183759. }
  183760. },
  183761. "cpu_I.decode_RS1_SB_LUT4_O_14_I2": {
  183762. "hide_name": 0,
  183763. "bits": [ 3708, 3728, 2963 ],
  183764. "attributes": {
  183765. "force_downto": "00000000000000000000000000000001",
  183766. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183767. }
  183768. },
  183769. "cpu_I.decode_RS1_SB_LUT4_O_14_I2_SB_LUT4_O_I3": {
  183770. "hide_name": 0,
  183771. "bits": [ 3715, 3153, 3730 ],
  183772. "attributes": {
  183773. "force_downto": "00000000000000000000000000000001",
  183774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183775. }
  183776. },
  183777. "cpu_I.decode_RS1_SB_LUT4_O_15_I2": {
  183778. "hide_name": 0,
  183779. "bits": [ 3708, 3731, 2960 ],
  183780. "attributes": {
  183781. "force_downto": "00000000000000000000000000000001",
  183782. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183783. }
  183784. },
  183785. "cpu_I.decode_RS1_SB_LUT4_O_15_I2_SB_LUT4_O_I3": {
  183786. "hide_name": 0,
  183787. "bits": [ 3715, 3146, 3733 ],
  183788. "attributes": {
  183789. "force_downto": "00000000000000000000000000000001",
  183790. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183791. }
  183792. },
  183793. "cpu_I.decode_RS1_SB_LUT4_O_16_I2": {
  183794. "hide_name": 0,
  183795. "bits": [ 3708, 3734, 2957 ],
  183796. "attributes": {
  183797. "force_downto": "00000000000000000000000000000001",
  183798. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183799. }
  183800. },
  183801. "cpu_I.decode_RS1_SB_LUT4_O_16_I2_SB_LUT4_O_I3": {
  183802. "hide_name": 0,
  183803. "bits": [ 3715, 3139, 3736 ],
  183804. "attributes": {
  183805. "force_downto": "00000000000000000000000000000001",
  183806. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183807. }
  183808. },
  183809. "cpu_I.decode_RS1_SB_LUT4_O_17_I2": {
  183810. "hide_name": 0,
  183811. "bits": [ 3708, 3737, 2945 ],
  183812. "attributes": {
  183813. "force_downto": "00000000000000000000000000000001",
  183814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183815. }
  183816. },
  183817. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O_I3": {
  183818. "hide_name": 0,
  183819. "bits": [ 3715, 3215, 3739 ],
  183820. "attributes": {
  183821. "force_downto": "00000000000000000000000000000001",
  183822. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183823. }
  183824. },
  183825. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  183826. "hide_name": 0,
  183827. "bits": [ 2323, 3740, 2299 ],
  183828. "attributes": {
  183829. "force_downto": "00000000000000000000000000000001",
  183830. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183831. }
  183832. },
  183833. "cpu_I.decode_RS1_SB_LUT4_O_17_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  183834. "hide_name": 0,
  183835. "bits": [ 2154, 3741, 2094 ],
  183836. "attributes": {
  183837. "force_downto": "00000000000000000000000000000001",
  183838. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183839. }
  183840. },
  183841. "cpu_I.decode_RS1_SB_LUT4_O_18_I2": {
  183842. "hide_name": 0,
  183843. "bits": [ 3708, 3742, 2942 ],
  183844. "attributes": {
  183845. "force_downto": "00000000000000000000000000000001",
  183846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183847. }
  183848. },
  183849. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O_I3": {
  183850. "hide_name": 0,
  183851. "bits": [ 3715, 3132, 3744 ],
  183852. "attributes": {
  183853. "force_downto": "00000000000000000000000000000001",
  183854. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183855. }
  183856. },
  183857. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  183858. "hide_name": 0,
  183859. "bits": [ 2323, 3745, 2300 ],
  183860. "attributes": {
  183861. "force_downto": "00000000000000000000000000000001",
  183862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183863. }
  183864. },
  183865. "cpu_I.decode_RS1_SB_LUT4_O_18_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  183866. "hide_name": 0,
  183867. "bits": [ 2146, 3746, 2094 ],
  183868. "attributes": {
  183869. "force_downto": "00000000000000000000000000000001",
  183870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183871. }
  183872. },
  183873. "cpu_I.decode_RS1_SB_LUT4_O_19_I2": {
  183874. "hide_name": 0,
  183875. "bits": [ 3708, 3747, 2939 ],
  183876. "attributes": {
  183877. "force_downto": "00000000000000000000000000000001",
  183878. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183879. }
  183880. },
  183881. "cpu_I.decode_RS1_SB_LUT4_O_19_I2_SB_LUT4_O_I3": {
  183882. "hide_name": 0,
  183883. "bits": [ 3715, 3222, 3749 ],
  183884. "attributes": {
  183885. "force_downto": "00000000000000000000000000000001",
  183886. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183887. }
  183888. },
  183889. "cpu_I.decode_RS1_SB_LUT4_O_1_I3": {
  183890. "hide_name": 0,
  183891. "bits": [ 3708, 3064, 3711 ],
  183892. "attributes": {
  183893. "force_downto": "00000000000000000000000000000001",
  183894. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183895. }
  183896. },
  183897. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  183898. "hide_name": 0,
  183899. "bits": [ 3715, 3251, 3750 ],
  183900. "attributes": {
  183901. "force_downto": "00000000000000000000000000000001",
  183902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183903. }
  183904. },
  183905. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  183906. "hide_name": 0,
  183907. "bits": [ 3715, 2323, 3751, 2284 ],
  183908. "attributes": {
  183909. "force_downto": "00000000000000000000000000000001",
  183910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183911. }
  183912. },
  183913. "cpu_I.decode_RS1_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  183914. "hide_name": 0,
  183915. "bits": [ 2068, 3752, 2094 ],
  183916. "attributes": {
  183917. "force_downto": "00000000000000000000000000000001",
  183918. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183919. }
  183920. },
  183921. "cpu_I.decode_RS1_SB_LUT4_O_20_I2": {
  183922. "hide_name": 0,
  183923. "bits": [ 3708, 3755, 2925 ],
  183924. "attributes": {
  183925. "force_downto": "00000000000000000000000000000001",
  183926. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183927. }
  183928. },
  183929. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O_I3": {
  183930. "hide_name": 0,
  183931. "bits": [ 3715, 3125, 3757 ],
  183932. "attributes": {
  183933. "force_downto": "00000000000000000000000000000001",
  183934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183935. }
  183936. },
  183937. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  183938. "hide_name": 0,
  183939. "bits": [ 2323, 3758, 2272 ],
  183940. "attributes": {
  183941. "force_downto": "00000000000000000000000000000001",
  183942. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183943. }
  183944. },
  183945. "cpu_I.decode_RS1_SB_LUT4_O_20_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  183946. "hide_name": 0,
  183947. "bits": [ 2142, 3759, 2094 ],
  183948. "attributes": {
  183949. "force_downto": "00000000000000000000000000000001",
  183950. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183951. }
  183952. },
  183953. "cpu_I.decode_RS1_SB_LUT4_O_21_I3": {
  183954. "hide_name": 0,
  183955. "bits": [ 3708, 2860, 3760 ],
  183956. "attributes": {
  183957. "force_downto": "00000000000000000000000000000001",
  183958. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183959. }
  183960. },
  183961. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O_I3": {
  183962. "hide_name": 0,
  183963. "bits": [ 3715, 3234, 3762 ],
  183964. "attributes": {
  183965. "force_downto": "00000000000000000000000000000001",
  183966. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183967. }
  183968. },
  183969. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  183970. "hide_name": 0,
  183971. "bits": [ 2323, 3763, 2293 ],
  183972. "attributes": {
  183973. "force_downto": "00000000000000000000000000000001",
  183974. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183975. }
  183976. },
  183977. "cpu_I.decode_RS1_SB_LUT4_O_21_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  183978. "hide_name": 0,
  183979. "bits": [ 2067, 3764, 2094 ],
  183980. "attributes": {
  183981. "force_downto": "00000000000000000000000000000001",
  183982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183983. }
  183984. },
  183985. "cpu_I.decode_RS1_SB_LUT4_O_22_I3": {
  183986. "hide_name": 0,
  183987. "bits": [ 3708, 2922, 3765 ],
  183988. "attributes": {
  183989. "force_downto": "00000000000000000000000000000001",
  183990. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183991. }
  183992. },
  183993. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O_I3": {
  183994. "hide_name": 0,
  183995. "bits": [ 3715, 3118, 3767 ],
  183996. "attributes": {
  183997. "force_downto": "00000000000000000000000000000001",
  183998. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  183999. }
  184000. },
  184001. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184002. "hide_name": 0,
  184003. "bits": [ 2323, 3768, 2273 ],
  184004. "attributes": {
  184005. "force_downto": "00000000000000000000000000000001",
  184006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184007. }
  184008. },
  184009. "cpu_I.decode_RS1_SB_LUT4_O_22_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184010. "hide_name": 0,
  184011. "bits": [ 2152, 3769, 2094 ],
  184012. "attributes": {
  184013. "force_downto": "00000000000000000000000000000001",
  184014. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184015. }
  184016. },
  184017. "cpu_I.decode_RS1_SB_LUT4_O_23_I3": {
  184018. "hide_name": 0,
  184019. "bits": [ 3708, 2919, 3770 ],
  184020. "attributes": {
  184021. "force_downto": "00000000000000000000000000000001",
  184022. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184023. }
  184024. },
  184025. "cpu_I.decode_RS1_SB_LUT4_O_23_I3_SB_LUT4_O_I3": {
  184026. "hide_name": 0,
  184027. "bits": [ 3715, 3111, 3772 ],
  184028. "attributes": {
  184029. "force_downto": "00000000000000000000000000000001",
  184030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184031. }
  184032. },
  184033. "cpu_I.decode_RS1_SB_LUT4_O_24_I3": {
  184034. "hide_name": 0,
  184035. "bits": [ 3708, 2916, 3773 ],
  184036. "attributes": {
  184037. "force_downto": "00000000000000000000000000000001",
  184038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184039. }
  184040. },
  184041. "cpu_I.decode_RS1_SB_LUT4_O_24_I3_SB_LUT4_O_I3": {
  184042. "hide_name": 0,
  184043. "bits": [ 3715, 3104, 3775 ],
  184044. "attributes": {
  184045. "force_downto": "00000000000000000000000000000001",
  184046. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184047. }
  184048. },
  184049. "cpu_I.decode_RS1_SB_LUT4_O_25_I3": {
  184050. "hide_name": 0,
  184051. "bits": [ 3708, 2904, 3776 ],
  184052. "attributes": {
  184053. "force_downto": "00000000000000000000000000000001",
  184054. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184055. }
  184056. },
  184057. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O_I3": {
  184058. "hide_name": 0,
  184059. "bits": [ 3715, 3099, 3778 ],
  184060. "attributes": {
  184061. "force_downto": "00000000000000000000000000000001",
  184062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184063. }
  184064. },
  184065. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184066. "hide_name": 0,
  184067. "bits": [ 2323, 3779, 2276 ],
  184068. "attributes": {
  184069. "force_downto": "00000000000000000000000000000001",
  184070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184071. }
  184072. },
  184073. "cpu_I.decode_RS1_SB_LUT4_O_25_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184074. "hide_name": 0,
  184075. "bits": [ 2140, 3780, 2094 ],
  184076. "attributes": {
  184077. "force_downto": "00000000000000000000000000000001",
  184078. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184079. }
  184080. },
  184081. "cpu_I.decode_RS1_SB_LUT4_O_26_I3": {
  184082. "hide_name": 0,
  184083. "bits": [ 3708, 2901, 3781 ],
  184084. "attributes": {
  184085. "force_downto": "00000000000000000000000000000001",
  184086. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184087. }
  184088. },
  184089. "cpu_I.decode_RS1_SB_LUT4_O_26_I3_SB_LUT4_O_I3": {
  184090. "hide_name": 0,
  184091. "bits": [ 3715, 3088, 3783 ],
  184092. "attributes": {
  184093. "force_downto": "00000000000000000000000000000001",
  184094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184095. }
  184096. },
  184097. "cpu_I.decode_RS1_SB_LUT4_O_27_I3": {
  184098. "hide_name": 0,
  184099. "bits": [ 3708, 2888, 3784 ],
  184100. "attributes": {
  184101. "force_downto": "00000000000000000000000000000001",
  184102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184103. }
  184104. },
  184105. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O_I3": {
  184106. "hide_name": 0,
  184107. "bits": [ 3715, 3271, 3786 ],
  184108. "attributes": {
  184109. "force_downto": "00000000000000000000000000000001",
  184110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184111. }
  184112. },
  184113. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184114. "hide_name": 0,
  184115. "bits": [ 3715, 2323, 3787, 2278 ],
  184116. "attributes": {
  184117. "force_downto": "00000000000000000000000000000001",
  184118. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184119. }
  184120. },
  184121. "cpu_I.decode_RS1_SB_LUT4_O_27_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184122. "hide_name": 0,
  184123. "bits": [ 2066, 3788, 2094 ],
  184124. "attributes": {
  184125. "force_downto": "00000000000000000000000000000001",
  184126. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184127. }
  184128. },
  184129. "cpu_I.decode_RS1_SB_LUT4_O_28_I3": {
  184130. "hide_name": 0,
  184131. "bits": [ 3708, 2885, 3789 ],
  184132. "attributes": {
  184133. "force_downto": "00000000000000000000000000000001",
  184134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184135. }
  184136. },
  184137. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O_I3": {
  184138. "hide_name": 0,
  184139. "bits": [ 3715, 3266, 3791 ],
  184140. "attributes": {
  184141. "force_downto": "00000000000000000000000000000001",
  184142. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184143. }
  184144. },
  184145. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184146. "hide_name": 0,
  184147. "bits": [ 3715, 2323, 3792, 2279 ],
  184148. "attributes": {
  184149. "force_downto": "00000000000000000000000000000001",
  184150. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184151. }
  184152. },
  184153. "cpu_I.decode_RS1_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184154. "hide_name": 0,
  184155. "bits": [ 2070, 3793, 2094 ],
  184156. "attributes": {
  184157. "force_downto": "00000000000000000000000000000001",
  184158. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184159. }
  184160. },
  184161. "cpu_I.decode_RS1_SB_LUT4_O_29_I3": {
  184162. "hide_name": 0,
  184163. "bits": [ 3708, 2875, 3794 ],
  184164. "attributes": {
  184165. "force_downto": "00000000000000000000000000000001",
  184166. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184167. }
  184168. },
  184169. "cpu_I.decode_RS1_SB_LUT4_O_29_I3_SB_LUT4_O_I3": {
  184170. "hide_name": 0,
  184171. "bits": [ 3715, 3261, 3796 ],
  184172. "attributes": {
  184173. "force_downto": "00000000000000000000000000000001",
  184174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184175. }
  184176. },
  184177. "cpu_I.decode_RS1_SB_LUT4_O_2_I3": {
  184178. "hide_name": 0,
  184179. "bits": [ 3708, 3050, 3753 ],
  184180. "attributes": {
  184181. "force_downto": "00000000000000000000000000000001",
  184182. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184183. }
  184184. },
  184185. "cpu_I.decode_RS1_SB_LUT4_O_2_I3_SB_LUT4_O_I3": {
  184186. "hide_name": 0,
  184187. "bits": [ 3715, 3184, 3797 ],
  184188. "attributes": {
  184189. "force_downto": "00000000000000000000000000000001",
  184190. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184191. }
  184192. },
  184193. "cpu_I.decode_RS1_SB_LUT4_O_30_I3": {
  184194. "hide_name": 0,
  184195. "bits": [ 3708, 2863, 3800 ],
  184196. "attributes": {
  184197. "force_downto": "00000000000000000000000000000001",
  184198. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184199. }
  184200. },
  184201. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O_I3": {
  184202. "hide_name": 0,
  184203. "bits": [ 3715, 3256, 3802 ],
  184204. "attributes": {
  184205. "force_downto": "00000000000000000000000000000001",
  184206. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184207. }
  184208. },
  184209. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184210. "hide_name": 0,
  184211. "bits": [ 3715, 2323, 3803, 2282 ],
  184212. "attributes": {
  184213. "force_downto": "00000000000000000000000000000001",
  184214. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184215. }
  184216. },
  184217. "cpu_I.decode_RS1_SB_LUT4_O_30_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184218. "hide_name": 0,
  184219. "bits": [ 2072, 3804, 2094 ],
  184220. "attributes": {
  184221. "force_downto": "00000000000000000000000000000001",
  184222. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184223. }
  184224. },
  184225. "cpu_I.decode_RS1_SB_LUT4_O_31_I3": {
  184226. "hide_name": 0,
  184227. "bits": [ 3708, 3067, 3805 ],
  184228. "attributes": {
  184229. "force_downto": "00000000000000000000000000000001",
  184230. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184231. }
  184232. },
  184233. "cpu_I.decode_RS1_SB_LUT4_O_31_I3_SB_LUT4_O_I3": {
  184234. "hide_name": 0,
  184235. "bits": [ 3715, 3239, 3807 ],
  184236. "attributes": {
  184237. "force_downto": "00000000000000000000000000000001",
  184238. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184239. }
  184240. },
  184241. "cpu_I.decode_RS1_SB_LUT4_O_3_I3": {
  184242. "hide_name": 0,
  184243. "bits": [ 3708, 3038, 3798 ],
  184244. "attributes": {
  184245. "force_downto": "00000000000000000000000000000001",
  184246. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184247. }
  184248. },
  184249. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O_I3": {
  184250. "hide_name": 0,
  184251. "bits": [ 3715, 3246, 3808 ],
  184252. "attributes": {
  184253. "force_downto": "00000000000000000000000000000001",
  184254. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184255. }
  184256. },
  184257. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184258. "hide_name": 0,
  184259. "bits": [ 2323, 3809, 2286 ],
  184260. "attributes": {
  184261. "force_downto": "00000000000000000000000000000001",
  184262. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184263. }
  184264. },
  184265. "cpu_I.decode_RS1_SB_LUT4_O_3_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184266. "hide_name": 0,
  184267. "bits": [ 2073, 3810, 2094 ],
  184268. "attributes": {
  184269. "force_downto": "00000000000000000000000000000001",
  184270. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184271. }
  184272. },
  184273. "cpu_I.decode_RS1_SB_LUT4_O_4_I3": {
  184274. "hide_name": 0,
  184275. "bits": [ 3708, 3025, 3811 ],
  184276. "attributes": {
  184277. "force_downto": "00000000000000000000000000000001",
  184278. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184279. }
  184280. },
  184281. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O_I3": {
  184282. "hide_name": 0,
  184283. "bits": [ 3715, 3231, 3813 ],
  184284. "attributes": {
  184285. "force_downto": "00000000000000000000000000000001",
  184286. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184287. }
  184288. },
  184289. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184290. "hide_name": 0,
  184291. "bits": [ 2323, 3814, 2287 ],
  184292. "attributes": {
  184293. "force_downto": "00000000000000000000000000000001",
  184294. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184295. }
  184296. },
  184297. "cpu_I.decode_RS1_SB_LUT4_O_4_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184298. "hide_name": 0,
  184299. "bits": [ 2065, 3815, 2094 ],
  184300. "attributes": {
  184301. "force_downto": "00000000000000000000000000000001",
  184302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184303. }
  184304. },
  184305. "cpu_I.decode_RS1_SB_LUT4_O_5_I3": {
  184306. "hide_name": 0,
  184307. "bits": [ 3708, 3003, 3816 ],
  184308. "attributes": {
  184309. "force_downto": "00000000000000000000000000000001",
  184310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184311. }
  184312. },
  184313. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O_I3": {
  184314. "hide_name": 0,
  184315. "bits": [ 3715, 3164, 3818 ],
  184316. "attributes": {
  184317. "force_downto": "00000000000000000000000000000001",
  184318. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184319. }
  184320. },
  184321. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184322. "hide_name": 0,
  184323. "bits": [ 2323, 3819, 2288 ],
  184324. "attributes": {
  184325. "force_downto": "00000000000000000000000000000001",
  184326. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184327. }
  184328. },
  184329. "cpu_I.decode_RS1_SB_LUT4_O_5_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184330. "hide_name": 0,
  184331. "bits": [ 2069, 3820, 2094 ],
  184332. "attributes": {
  184333. "force_downto": "00000000000000000000000000000001",
  184334. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184335. }
  184336. },
  184337. "cpu_I.decode_RS1_SB_LUT4_O_6_I3": {
  184338. "hide_name": 0,
  184339. "bits": [ 3708, 2976, 3821 ],
  184340. "attributes": {
  184341. "force_downto": "00000000000000000000000000000001",
  184342. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184343. }
  184344. },
  184345. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O_I3": {
  184346. "hide_name": 0,
  184347. "bits": [ 3715, 3085, 3823 ],
  184348. "attributes": {
  184349. "force_downto": "00000000000000000000000000000001",
  184350. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184351. }
  184352. },
  184353. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  184354. "hide_name": 0,
  184355. "bits": [ 2289, 2323, 3824 ],
  184356. "attributes": {
  184357. "force_downto": "00000000000000000000000000000001",
  184358. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184359. }
  184360. },
  184361. "cpu_I.decode_RS1_SB_LUT4_O_6_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184362. "hide_name": 0,
  184363. "bits": [ 2061, 3825, 2094 ],
  184364. "attributes": {
  184365. "force_downto": "00000000000000000000000000000001",
  184366. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184367. }
  184368. },
  184369. "cpu_I.decode_RS1_SB_LUT4_O_7_I3": {
  184370. "hide_name": 0,
  184371. "bits": [ 3708, 2936, 3826 ],
  184372. "attributes": {
  184373. "force_downto": "00000000000000000000000000000001",
  184374. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184375. }
  184376. },
  184377. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O_I3": {
  184378. "hide_name": 0,
  184379. "bits": [ 3715, 3082, 3828 ],
  184380. "attributes": {
  184381. "force_downto": "00000000000000000000000000000001",
  184382. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184383. }
  184384. },
  184385. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  184386. "hide_name": 0,
  184387. "bits": [ 2290, 2323, 3829 ],
  184388. "attributes": {
  184389. "force_downto": "00000000000000000000000000000001",
  184390. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184391. }
  184392. },
  184393. "cpu_I.decode_RS1_SB_LUT4_O_7_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184394. "hide_name": 0,
  184395. "bits": [ 2071, 3830, 2094 ],
  184396. "attributes": {
  184397. "force_downto": "00000000000000000000000000000001",
  184398. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184399. }
  184400. },
  184401. "cpu_I.decode_RS1_SB_LUT4_O_8_I2": {
  184402. "hide_name": 0,
  184403. "bits": [ 3708, 3831, 2971 ],
  184404. "attributes": {
  184405. "force_downto": "00000000000000000000000000000001",
  184406. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184407. }
  184408. },
  184409. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O_I3": {
  184410. "hide_name": 0,
  184411. "bits": [ 3715, 3172, 3833 ],
  184412. "attributes": {
  184413. "force_downto": "00000000000000000000000000000001",
  184414. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184415. }
  184416. },
  184417. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184418. "hide_name": 0,
  184419. "bits": [ 3715, 2323, 3834, 2269 ],
  184420. "attributes": {
  184421. "force_downto": "00000000000000000000000000000001",
  184422. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184423. }
  184424. },
  184425. "cpu_I.decode_RS1_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184426. "hide_name": 0,
  184427. "bits": [ 2155, 3835, 2094 ],
  184428. "attributes": {
  184429. "force_downto": "00000000000000000000000000000001",
  184430. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184431. }
  184432. },
  184433. "cpu_I.decode_RS1_SB_LUT4_O_9_I2": {
  184434. "hide_name": 0,
  184435. "bits": [ 3708, 3836, 2969 ],
  184436. "attributes": {
  184437. "force_downto": "00000000000000000000000000000001",
  184438. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184439. }
  184440. },
  184441. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O_I3": {
  184442. "hide_name": 0,
  184443. "bits": [ 3715, 3189, 3838 ],
  184444. "attributes": {
  184445. "force_downto": "00000000000000000000000000000001",
  184446. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184447. }
  184448. },
  184449. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184450. "hide_name": 0,
  184451. "bits": [ 2323, 3839, 2270 ],
  184452. "attributes": {
  184453. "force_downto": "00000000000000000000000000000001",
  184454. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184455. }
  184456. },
  184457. "cpu_I.decode_RS1_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184458. "hide_name": 0,
  184459. "bits": [ 2147, 3840, 2094 ],
  184460. "attributes": {
  184461. "force_downto": "00000000000000000000000000000001",
  184462. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184463. }
  184464. },
  184465. "cpu_I.decode_RS2": {
  184466. "hide_name": 0,
  184467. "bits": [ 3843, 3895, 3847, 3953, 3950, 3947, 3944, 3933, 3890, 3845, 3938, 3935, 3925, 3922, 3919, 3914, 3911, 3906, 3901, 3898, 3892, 3884, 3881, 3878, 3873, 3868, 3866, 3861, 3856, 3851, 3959, 3956 ],
  184468. "attributes": {
  184469. "hdlname": "cpu_I decode_RS2",
  184470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:774.23-774.33"
  184471. }
  184472. },
  184473. "cpu_I.decode_RS2_SB_LUT4_O_10_I3": {
  184474. "hide_name": 0,
  184475. "bits": [ 3841, 2861, 3846 ],
  184476. "attributes": {
  184477. "force_downto": "00000000000000000000000000000001",
  184478. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184479. }
  184480. },
  184481. "cpu_I.decode_RS2_SB_LUT4_O_10_I3_SB_LUT4_O_I3": {
  184482. "hide_name": 0,
  184483. "bits": [ 3848, 3196, 3849 ],
  184484. "attributes": {
  184485. "force_downto": "00000000000000000000000000000001",
  184486. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184487. }
  184488. },
  184489. "cpu_I.decode_RS2_SB_LUT4_O_11_I2": {
  184490. "hide_name": 0,
  184491. "bits": [ 3841, 3850, 2980 ],
  184492. "attributes": {
  184493. "force_downto": "00000000000000000000000000000001",
  184494. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184495. }
  184496. },
  184497. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O_I3": {
  184498. "hide_name": 0,
  184499. "bits": [ 3848, 3203, 3852 ],
  184500. "attributes": {
  184501. "force_downto": "00000000000000000000000000000001",
  184502. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184503. }
  184504. },
  184505. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184506. "hide_name": 0,
  184507. "bits": [ 3848, 2112, 3853, 2281 ],
  184508. "attributes": {
  184509. "force_downto": "00000000000000000000000000000001",
  184510. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184511. }
  184512. },
  184513. "cpu_I.decode_RS2_SB_LUT4_O_11_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184514. "hide_name": 0,
  184515. "bits": [ 2151, 3854, 2080 ],
  184516. "attributes": {
  184517. "force_downto": "00000000000000000000000000000001",
  184518. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184519. }
  184520. },
  184521. "cpu_I.decode_RS2_SB_LUT4_O_12_I2": {
  184522. "hide_name": 0,
  184523. "bits": [ 3841, 3855, 2984 ],
  184524. "attributes": {
  184525. "force_downto": "00000000000000000000000000000001",
  184526. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184527. }
  184528. },
  184529. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O_I3": {
  184530. "hide_name": 0,
  184531. "bits": [ 3848, 3208, 3857 ],
  184532. "attributes": {
  184533. "force_downto": "00000000000000000000000000000001",
  184534. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184535. }
  184536. },
  184537. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184538. "hide_name": 0,
  184539. "bits": [ 3848, 2112, 3858, 2292 ],
  184540. "attributes": {
  184541. "force_downto": "00000000000000000000000000000001",
  184542. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184543. }
  184544. },
  184545. "cpu_I.decode_RS2_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184546. "hide_name": 0,
  184547. "bits": [ 2143, 3859, 2080 ],
  184548. "attributes": {
  184549. "force_downto": "00000000000000000000000000000001",
  184550. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184551. }
  184552. },
  184553. "cpu_I.decode_RS2_SB_LUT4_O_13_I2": {
  184554. "hide_name": 0,
  184555. "bits": [ 3841, 3860, 2966 ],
  184556. "attributes": {
  184557. "force_downto": "00000000000000000000000000000001",
  184558. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184559. }
  184560. },
  184561. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O_I3": {
  184562. "hide_name": 0,
  184563. "bits": [ 3848, 3167, 3841, 3862 ],
  184564. "attributes": {
  184565. "force_downto": "00000000000000000000000000000001",
  184566. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184567. }
  184568. },
  184569. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184570. "hide_name": 0,
  184571. "bits": [ 2112, 3863, 2295 ],
  184572. "attributes": {
  184573. "force_downto": "00000000000000000000000000000001",
  184574. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184575. }
  184576. },
  184577. "cpu_I.decode_RS2_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184578. "hide_name": 0,
  184579. "bits": [ 2153, 3864, 2080 ],
  184580. "attributes": {
  184581. "force_downto": "00000000000000000000000000000001",
  184582. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184583. }
  184584. },
  184585. "cpu_I.decode_RS2_SB_LUT4_O_15_I2": {
  184586. "hide_name": 0,
  184587. "bits": [ 3841, 3867, 2960 ],
  184588. "attributes": {
  184589. "force_downto": "00000000000000000000000000000001",
  184590. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184591. }
  184592. },
  184593. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O_I3": {
  184594. "hide_name": 0,
  184595. "bits": [ 3848, 3146, 3841, 3869 ],
  184596. "attributes": {
  184597. "force_downto": "00000000000000000000000000000001",
  184598. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184599. }
  184600. },
  184601. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184602. "hide_name": 0,
  184603. "bits": [ 2112, 3870, 2297 ],
  184604. "attributes": {
  184605. "force_downto": "00000000000000000000000000000001",
  184606. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184607. }
  184608. },
  184609. "cpu_I.decode_RS2_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184610. "hide_name": 0,
  184611. "bits": [ 2149, 3871, 2080 ],
  184612. "attributes": {
  184613. "force_downto": "00000000000000000000000000000001",
  184614. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184615. }
  184616. },
  184617. "cpu_I.decode_RS2_SB_LUT4_O_16_I2": {
  184618. "hide_name": 0,
  184619. "bits": [ 3841, 3872, 2957 ],
  184620. "attributes": {
  184621. "force_downto": "00000000000000000000000000000001",
  184622. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184623. }
  184624. },
  184625. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O_I3": {
  184626. "hide_name": 0,
  184627. "bits": [ 3848, 3139, 3841, 3874 ],
  184628. "attributes": {
  184629. "force_downto": "00000000000000000000000000000001",
  184630. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184631. }
  184632. },
  184633. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184634. "hide_name": 0,
  184635. "bits": [ 2112, 3875, 2298 ],
  184636. "attributes": {
  184637. "force_downto": "00000000000000000000000000000001",
  184638. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184639. }
  184640. },
  184641. "cpu_I.decode_RS2_SB_LUT4_O_16_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184642. "hide_name": 0,
  184643. "bits": [ 2141, 3876, 2080 ],
  184644. "attributes": {
  184645. "force_downto": "00000000000000000000000000000001",
  184646. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184647. }
  184648. },
  184649. "cpu_I.decode_RS2_SB_LUT4_O_17_I2": {
  184650. "hide_name": 0,
  184651. "bits": [ 3841, 3877, 2945 ],
  184652. "attributes": {
  184653. "force_downto": "00000000000000000000000000000001",
  184654. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184655. }
  184656. },
  184657. "cpu_I.decode_RS2_SB_LUT4_O_17_I2_SB_LUT4_O_I3": {
  184658. "hide_name": 0,
  184659. "bits": [ 3848, 3215, 3879 ],
  184660. "attributes": {
  184661. "force_downto": "00000000000000000000000000000001",
  184662. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184663. }
  184664. },
  184665. "cpu_I.decode_RS2_SB_LUT4_O_18_I2": {
  184666. "hide_name": 0,
  184667. "bits": [ 3841, 3880, 2942 ],
  184668. "attributes": {
  184669. "force_downto": "00000000000000000000000000000001",
  184670. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184671. }
  184672. },
  184673. "cpu_I.decode_RS2_SB_LUT4_O_18_I2_SB_LUT4_O_I3": {
  184674. "hide_name": 0,
  184675. "bits": [ 3848, 3132, 3841, 3882 ],
  184676. "attributes": {
  184677. "force_downto": "00000000000000000000000000000001",
  184678. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184679. }
  184680. },
  184681. "cpu_I.decode_RS2_SB_LUT4_O_19_I2": {
  184682. "hide_name": 0,
  184683. "bits": [ 3841, 3883, 2939 ],
  184684. "attributes": {
  184685. "force_downto": "00000000000000000000000000000001",
  184686. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184687. }
  184688. },
  184689. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O_I3": {
  184690. "hide_name": 0,
  184691. "bits": [ 3848, 3222, 3885 ],
  184692. "attributes": {
  184693. "force_downto": "00000000000000000000000000000001",
  184694. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184695. }
  184696. },
  184697. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184698. "hide_name": 0,
  184699. "bits": [ 3848, 2112, 3886, 2271 ],
  184700. "attributes": {
  184701. "force_downto": "00000000000000000000000000000001",
  184702. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184703. }
  184704. },
  184705. "cpu_I.decode_RS2_SB_LUT4_O_19_I2_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184706. "hide_name": 0,
  184707. "bits": [ 2150, 3887, 2080 ],
  184708. "attributes": {
  184709. "force_downto": "00000000000000000000000000000001",
  184710. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184711. }
  184712. },
  184713. "cpu_I.decode_RS2_SB_LUT4_O_1_I3": {
  184714. "hide_name": 0,
  184715. "bits": [ 3841, 3064, 3844 ],
  184716. "attributes": {
  184717. "force_downto": "00000000000000000000000000000001",
  184718. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184719. }
  184720. },
  184721. "cpu_I.decode_RS2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  184722. "hide_name": 0,
  184723. "bits": [ 3848, 3251, 3888 ],
  184724. "attributes": {
  184725. "force_downto": "00000000000000000000000000000001",
  184726. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184727. }
  184728. },
  184729. "cpu_I.decode_RS2_SB_LUT4_O_20_I2": {
  184730. "hide_name": 0,
  184731. "bits": [ 3841, 3891, 2925 ],
  184732. "attributes": {
  184733. "force_downto": "00000000000000000000000000000001",
  184734. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184735. }
  184736. },
  184737. "cpu_I.decode_RS2_SB_LUT4_O_20_I2_SB_LUT4_O_I3": {
  184738. "hide_name": 0,
  184739. "bits": [ 3848, 3125, 3893 ],
  184740. "attributes": {
  184741. "force_downto": "00000000000000000000000000000001",
  184742. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184743. }
  184744. },
  184745. "cpu_I.decode_RS2_SB_LUT4_O_21_I3": {
  184746. "hide_name": 0,
  184747. "bits": [ 3841, 2860, 3894 ],
  184748. "attributes": {
  184749. "force_downto": "00000000000000000000000000000001",
  184750. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184751. }
  184752. },
  184753. "cpu_I.decode_RS2_SB_LUT4_O_21_I3_SB_LUT4_O_I3": {
  184754. "hide_name": 0,
  184755. "bits": [ 3848, 3234, 3896 ],
  184756. "attributes": {
  184757. "force_downto": "00000000000000000000000000000001",
  184758. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184759. }
  184760. },
  184761. "cpu_I.decode_RS2_SB_LUT4_O_22_I3": {
  184762. "hide_name": 0,
  184763. "bits": [ 3841, 2922, 3897 ],
  184764. "attributes": {
  184765. "force_downto": "00000000000000000000000000000001",
  184766. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184767. }
  184768. },
  184769. "cpu_I.decode_RS2_SB_LUT4_O_22_I3_SB_LUT4_O_I3": {
  184770. "hide_name": 0,
  184771. "bits": [ 3848, 3118, 3899 ],
  184772. "attributes": {
  184773. "force_downto": "00000000000000000000000000000001",
  184774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184775. }
  184776. },
  184777. "cpu_I.decode_RS2_SB_LUT4_O_23_I3": {
  184778. "hide_name": 0,
  184779. "bits": [ 3841, 2919, 3900 ],
  184780. "attributes": {
  184781. "force_downto": "00000000000000000000000000000001",
  184782. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184783. }
  184784. },
  184785. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O_I3": {
  184786. "hide_name": 0,
  184787. "bits": [ 3848, 3111, 3841, 3902 ],
  184788. "attributes": {
  184789. "force_downto": "00000000000000000000000000000001",
  184790. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184791. }
  184792. },
  184793. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184794. "hide_name": 0,
  184795. "bits": [ 2112, 3903, 2274 ],
  184796. "attributes": {
  184797. "force_downto": "00000000000000000000000000000001",
  184798. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184799. }
  184800. },
  184801. "cpu_I.decode_RS2_SB_LUT4_O_23_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184802. "hide_name": 0,
  184803. "bits": [ 2144, 3904, 2080 ],
  184804. "attributes": {
  184805. "force_downto": "00000000000000000000000000000001",
  184806. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184807. }
  184808. },
  184809. "cpu_I.decode_RS2_SB_LUT4_O_24_I3": {
  184810. "hide_name": 0,
  184811. "bits": [ 3841, 2916, 3905 ],
  184812. "attributes": {
  184813. "force_downto": "00000000000000000000000000000001",
  184814. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184815. }
  184816. },
  184817. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O_I3": {
  184818. "hide_name": 0,
  184819. "bits": [ 3848, 3104, 3841, 3907 ],
  184820. "attributes": {
  184821. "force_downto": "00000000000000000000000000000001",
  184822. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184823. }
  184824. },
  184825. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184826. "hide_name": 0,
  184827. "bits": [ 2112, 3908, 2275 ],
  184828. "attributes": {
  184829. "force_downto": "00000000000000000000000000000001",
  184830. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184831. }
  184832. },
  184833. "cpu_I.decode_RS2_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184834. "hide_name": 0,
  184835. "bits": [ 2148, 3909, 2080 ],
  184836. "attributes": {
  184837. "force_downto": "00000000000000000000000000000001",
  184838. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184839. }
  184840. },
  184841. "cpu_I.decode_RS2_SB_LUT4_O_25_I3": {
  184842. "hide_name": 0,
  184843. "bits": [ 3841, 2904, 3910 ],
  184844. "attributes": {
  184845. "force_downto": "00000000000000000000000000000001",
  184846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184847. }
  184848. },
  184849. "cpu_I.decode_RS2_SB_LUT4_O_25_I3_SB_LUT4_O_I3": {
  184850. "hide_name": 0,
  184851. "bits": [ 3848, 3099, 3841, 3912 ],
  184852. "attributes": {
  184853. "force_downto": "00000000000000000000000000000001",
  184854. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184855. }
  184856. },
  184857. "cpu_I.decode_RS2_SB_LUT4_O_26_I3": {
  184858. "hide_name": 0,
  184859. "bits": [ 3841, 2901, 3913 ],
  184860. "attributes": {
  184861. "force_downto": "00000000000000000000000000000001",
  184862. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184863. }
  184864. },
  184865. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O_I3": {
  184866. "hide_name": 0,
  184867. "bits": [ 3848, 3088, 3915 ],
  184868. "attributes": {
  184869. "force_downto": "00000000000000000000000000000001",
  184870. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184871. }
  184872. },
  184873. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184874. "hide_name": 0,
  184875. "bits": [ 3848, 2112, 3916, 2277 ],
  184876. "attributes": {
  184877. "force_downto": "00000000000000000000000000000001",
  184878. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184879. }
  184880. },
  184881. "cpu_I.decode_RS2_SB_LUT4_O_26_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184882. "hide_name": 0,
  184883. "bits": [ 2074, 3917, 2080 ],
  184884. "attributes": {
  184885. "force_downto": "00000000000000000000000000000001",
  184886. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184887. }
  184888. },
  184889. "cpu_I.decode_RS2_SB_LUT4_O_27_I3": {
  184890. "hide_name": 0,
  184891. "bits": [ 3841, 2888, 3918 ],
  184892. "attributes": {
  184893. "force_downto": "00000000000000000000000000000001",
  184894. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184895. }
  184896. },
  184897. "cpu_I.decode_RS2_SB_LUT4_O_27_I3_SB_LUT4_O_I3": {
  184898. "hide_name": 0,
  184899. "bits": [ 3848, 3271, 3920 ],
  184900. "attributes": {
  184901. "force_downto": "00000000000000000000000000000001",
  184902. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184903. }
  184904. },
  184905. "cpu_I.decode_RS2_SB_LUT4_O_28_I3": {
  184906. "hide_name": 0,
  184907. "bits": [ 3841, 2885, 3921 ],
  184908. "attributes": {
  184909. "force_downto": "00000000000000000000000000000001",
  184910. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184911. }
  184912. },
  184913. "cpu_I.decode_RS2_SB_LUT4_O_28_I3_SB_LUT4_O_I3": {
  184914. "hide_name": 0,
  184915. "bits": [ 3848, 3266, 3923 ],
  184916. "attributes": {
  184917. "force_downto": "00000000000000000000000000000001",
  184918. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184919. }
  184920. },
  184921. "cpu_I.decode_RS2_SB_LUT4_O_29_I3": {
  184922. "hide_name": 0,
  184923. "bits": [ 3841, 2875, 3924 ],
  184924. "attributes": {
  184925. "force_downto": "00000000000000000000000000000001",
  184926. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184927. }
  184928. },
  184929. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O_I3": {
  184930. "hide_name": 0,
  184931. "bits": [ 3848, 3261, 3926 ],
  184932. "attributes": {
  184933. "force_downto": "00000000000000000000000000000001",
  184934. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184935. }
  184936. },
  184937. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184938. "hide_name": 0,
  184939. "bits": [ 2112, 3927, 2280 ],
  184940. "attributes": {
  184941. "force_downto": "00000000000000000000000000000001",
  184942. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184943. }
  184944. },
  184945. "cpu_I.decode_RS2_SB_LUT4_O_29_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  184946. "hide_name": 0,
  184947. "bits": [ 2062, 3928, 2112, 2080 ],
  184948. "attributes": {
  184949. "force_downto": "00000000000000000000000000000001",
  184950. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184951. }
  184952. },
  184953. "cpu_I.decode_RS2_SB_LUT4_O_2_I3": {
  184954. "hide_name": 0,
  184955. "bits": [ 3841, 3050, 3889 ],
  184956. "attributes": {
  184957. "force_downto": "00000000000000000000000000000001",
  184958. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184959. }
  184960. },
  184961. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O_I3": {
  184962. "hide_name": 0,
  184963. "bits": [ 3848, 3184, 3929 ],
  184964. "attributes": {
  184965. "force_downto": "00000000000000000000000000000001",
  184966. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184967. }
  184968. },
  184969. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  184970. "hide_name": 0,
  184971. "bits": [ 3848, 2112, 3930, 2285 ],
  184972. "attributes": {
  184973. "force_downto": "00000000000000000000000000000001",
  184974. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184975. }
  184976. },
  184977. "cpu_I.decode_RS2_SB_LUT4_O_2_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  184978. "hide_name": 0,
  184979. "bits": [ 2060, 3931, 2080 ],
  184980. "attributes": {
  184981. "force_downto": "00000000000000000000000000000001",
  184982. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184983. }
  184984. },
  184985. "cpu_I.decode_RS2_SB_LUT4_O_30_I3": {
  184986. "hide_name": 0,
  184987. "bits": [ 3841, 2863, 3934 ],
  184988. "attributes": {
  184989. "force_downto": "00000000000000000000000000000001",
  184990. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184991. }
  184992. },
  184993. "cpu_I.decode_RS2_SB_LUT4_O_30_I3_SB_LUT4_O_I3": {
  184994. "hide_name": 0,
  184995. "bits": [ 3848, 3256, 3936 ],
  184996. "attributes": {
  184997. "force_downto": "00000000000000000000000000000001",
  184998. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  184999. }
  185000. },
  185001. "cpu_I.decode_RS2_SB_LUT4_O_31_I3": {
  185002. "hide_name": 0,
  185003. "bits": [ 3841, 3067, 3937 ],
  185004. "attributes": {
  185005. "force_downto": "00000000000000000000000000000001",
  185006. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185007. }
  185008. },
  185009. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O_I3": {
  185010. "hide_name": 0,
  185011. "bits": [ 3848, 3239, 3939 ],
  185012. "attributes": {
  185013. "force_downto": "00000000000000000000000000000001",
  185014. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185015. }
  185016. },
  185017. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  185018. "hide_name": 0,
  185019. "bits": [ 3848, 2112, 3940, 2283 ],
  185020. "attributes": {
  185021. "force_downto": "00000000000000000000000000000001",
  185022. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185023. }
  185024. },
  185025. "cpu_I.decode_RS2_SB_LUT4_O_31_I3_SB_LUT4_O_I3_SB_LUT4_O_I2_SB_LUT4_O_I2": {
  185026. "hide_name": 0,
  185027. "bits": [ 2064, 3941, 2080 ],
  185028. "attributes": {
  185029. "force_downto": "00000000000000000000000000000001",
  185030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185031. }
  185032. },
  185033. "cpu_I.decode_RS2_SB_LUT4_O_3_I3": {
  185034. "hide_name": 0,
  185035. "bits": [ 3841, 3038, 3932 ],
  185036. "attributes": {
  185037. "force_downto": "00000000000000000000000000000001",
  185038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185039. }
  185040. },
  185041. "cpu_I.decode_RS2_SB_LUT4_O_3_I3_SB_LUT4_O_I3": {
  185042. "hide_name": 0,
  185043. "bits": [ 3848, 3246, 3942 ],
  185044. "attributes": {
  185045. "force_downto": "00000000000000000000000000000001",
  185046. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185047. }
  185048. },
  185049. "cpu_I.decode_RS2_SB_LUT4_O_4_I3": {
  185050. "hide_name": 0,
  185051. "bits": [ 3841, 3025, 3943 ],
  185052. "attributes": {
  185053. "force_downto": "00000000000000000000000000000001",
  185054. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185055. }
  185056. },
  185057. "cpu_I.decode_RS2_SB_LUT4_O_4_I3_SB_LUT4_O_I3": {
  185058. "hide_name": 0,
  185059. "bits": [ 3848, 3231, 3945 ],
  185060. "attributes": {
  185061. "force_downto": "00000000000000000000000000000001",
  185062. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185063. }
  185064. },
  185065. "cpu_I.decode_RS2_SB_LUT4_O_5_I3": {
  185066. "hide_name": 0,
  185067. "bits": [ 3841, 3003, 3946 ],
  185068. "attributes": {
  185069. "force_downto": "00000000000000000000000000000001",
  185070. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185071. }
  185072. },
  185073. "cpu_I.decode_RS2_SB_LUT4_O_5_I3_SB_LUT4_O_I3": {
  185074. "hide_name": 0,
  185075. "bits": [ 3848, 3164, 3948 ],
  185076. "attributes": {
  185077. "force_downto": "00000000000000000000000000000001",
  185078. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185079. }
  185080. },
  185081. "cpu_I.decode_RS2_SB_LUT4_O_6_I3": {
  185082. "hide_name": 0,
  185083. "bits": [ 3841, 2976, 3949 ],
  185084. "attributes": {
  185085. "force_downto": "00000000000000000000000000000001",
  185086. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185087. }
  185088. },
  185089. "cpu_I.decode_RS2_SB_LUT4_O_6_I3_SB_LUT4_O_I3": {
  185090. "hide_name": 0,
  185091. "bits": [ 3848, 3085, 3951 ],
  185092. "attributes": {
  185093. "force_downto": "00000000000000000000000000000001",
  185094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185095. }
  185096. },
  185097. "cpu_I.decode_RS2_SB_LUT4_O_7_I3": {
  185098. "hide_name": 0,
  185099. "bits": [ 3841, 2936, 3952 ],
  185100. "attributes": {
  185101. "force_downto": "00000000000000000000000000000001",
  185102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185103. }
  185104. },
  185105. "cpu_I.decode_RS2_SB_LUT4_O_7_I3_SB_LUT4_O_I3": {
  185106. "hide_name": 0,
  185107. "bits": [ 3848, 3082, 3954 ],
  185108. "attributes": {
  185109. "force_downto": "00000000000000000000000000000001",
  185110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185111. }
  185112. },
  185113. "cpu_I.decode_RS2_SB_LUT4_O_8_I2": {
  185114. "hide_name": 0,
  185115. "bits": [ 3841, 3955, 2971 ],
  185116. "attributes": {
  185117. "force_downto": "00000000000000000000000000000001",
  185118. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185119. }
  185120. },
  185121. "cpu_I.decode_RS2_SB_LUT4_O_8_I2_SB_LUT4_O_I3": {
  185122. "hide_name": 0,
  185123. "bits": [ 3848, 3172, 3841, 3957 ],
  185124. "attributes": {
  185125. "force_downto": "00000000000000000000000000000001",
  185126. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185127. }
  185128. },
  185129. "cpu_I.decode_RS2_SB_LUT4_O_9_I2": {
  185130. "hide_name": 0,
  185131. "bits": [ 3841, 3958, 2969 ],
  185132. "attributes": {
  185133. "force_downto": "00000000000000000000000000000001",
  185134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185135. }
  185136. },
  185137. "cpu_I.decode_RS2_SB_LUT4_O_9_I2_SB_LUT4_O_I3": {
  185138. "hide_name": 0,
  185139. "bits": [ 3848, 3189, 3960 ],
  185140. "attributes": {
  185141. "force_downto": "00000000000000000000000000000001",
  185142. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185143. }
  185144. },
  185145. "cpu_I.decode_RS2_SB_LUT4_O_I2": {
  185146. "hide_name": 0,
  185147. "bits": [ 3841, 3842, 2970 ],
  185148. "attributes": {
  185149. "force_downto": "00000000000000000000000000000001",
  185150. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185151. }
  185152. },
  185153. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  185154. "hide_name": 0,
  185155. "bits": [ 3848, 3179, 3961 ],
  185156. "attributes": {
  185157. "force_downto": "00000000000000000000000000000001",
  185158. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185159. }
  185160. },
  185161. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  185162. "hide_name": 0,
  185163. "bits": [ 2112, 2294, 3962 ],
  185164. "attributes": {
  185165. "force_downto": "00000000000000000000000000000001",
  185166. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185167. }
  185168. },
  185169. "cpu_I.decode_RS2_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  185170. "hide_name": 0,
  185171. "bits": [ 2059, 3963, 2080 ],
  185172. "attributes": {
  185173. "force_downto": "00000000000000000000000000000001",
  185174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185175. }
  185176. },
  185177. "cpu_I.decode_RegFilePlugin_regFileReadAddress1": {
  185178. "hide_name": 0,
  185179. "bits": [ 7117, 7118, 7119, 7120, 7121, 7127 ],
  185180. "attributes": {
  185181. "hdlname": "cpu_I decode_RegFilePlugin_regFileReadAddress1",
  185182. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1089.23-1089.63",
  185183. "unused_bits": "0 1 2 3 4 5"
  185184. }
  185185. },
  185186. "cpu_I.decode_RegFilePlugin_regFileReadAddress2": {
  185187. "hide_name": 0,
  185188. "bits": [ 7122, 7123, 7124, 7125, 7126, 7128 ],
  185189. "attributes": {
  185190. "hdlname": "cpu_I decode_RegFilePlugin_regFileReadAddress2",
  185191. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1090.23-1090.63",
  185192. "unused_bits": "0 1 2 3 4 5"
  185193. }
  185194. },
  185195. "cpu_I.decode_SHIFT_CTRL": {
  185196. "hide_name": 0,
  185197. "bits": [ 3294, 3291 ],
  185198. "attributes": {
  185199. "hdlname": "cpu_I decode_SHIFT_CTRL",
  185200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:717.20-717.37"
  185201. }
  185202. },
  185203. "cpu_I.decode_SRC1_CTRL": {
  185204. "hide_name": 0,
  185205. "bits": [ 2857, 2856 ],
  185206. "attributes": {
  185207. "hdlname": "cpu_I decode_SRC1_CTRL",
  185208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:682.20-682.36"
  185209. }
  185210. },
  185211. "cpu_I.decode_SRC2_CTRL": {
  185212. "hide_name": 0,
  185213. "bits": [ 2331, 2330 ],
  185214. "attributes": {
  185215. "hdlname": "cpu_I decode_SRC2_CTRL",
  185216. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:674.20-674.36"
  185217. }
  185218. },
  185219. "cpu_I.decode_SRC2_FORCE_ZERO": {
  185220. "hide_name": 0,
  185221. "bits": [ 3964 ],
  185222. "attributes": {
  185223. "hdlname": "cpu_I decode_SRC2_FORCE_ZERO",
  185224. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:729.23-729.45"
  185225. }
  185226. },
  185227. "cpu_I.decode_SRC_LESS_UNSIGNED": {
  185228. "hide_name": 0,
  185229. "bits": [ 2340 ],
  185230. "attributes": {
  185231. "hdlname": "cpu_I decode_SRC_LESS_UNSIGNED",
  185232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:707.23-707.47"
  185233. }
  185234. },
  185235. "cpu_I.decode_SRC_USE_SUB_LESS": {
  185236. "hide_name": 0,
  185237. "bits": [ 3966 ],
  185238. "attributes": {
  185239. "hdlname": "cpu_I decode_SRC_USE_SUB_LESS",
  185240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:790.23-790.46"
  185241. }
  185242. },
  185243. "cpu_I.decode_SRC_USE_SUB_LESS_SB_LUT4_O_I3": {
  185244. "hide_name": 0,
  185245. "bits": [ 1363, 2328, 3965 ],
  185246. "attributes": {
  185247. "force_downto": "00000000000000000000000000000001",
  185248. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185249. }
  185250. },
  185251. "cpu_I.decode_arbitration_flushIt": {
  185252. "hide_name": 0,
  185253. "bits": [ "0" ],
  185254. "attributes": {
  185255. "hdlname": "cpu_I decode_arbitration_flushIt",
  185256. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:858.23-858.49"
  185257. }
  185258. },
  185259. "cpu_I.decode_arbitration_haltItself": {
  185260. "hide_name": 0,
  185261. "bits": [ "0" ],
  185262. "attributes": {
  185263. "hdlname": "cpu_I decode_arbitration_haltItself",
  185264. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:855.23-855.52"
  185265. }
  185266. },
  185267. "cpu_I.decode_to_execute_ALU_BITWISE_CTRL": {
  185268. "hide_name": 0,
  185269. "bits": [ 1250, 966 ],
  185270. "attributes": {
  185271. "hdlname": "cpu_I decode_to_execute_ALU_BITWISE_CTRL",
  185272. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1275.20-1275.54"
  185273. }
  185274. },
  185275. "cpu_I.decode_to_execute_ALU_CTRL": {
  185276. "hide_name": 0,
  185277. "bits": [ 1247, 1246 ],
  185278. "attributes": {
  185279. "hdlname": "cpu_I decode_to_execute_ALU_CTRL",
  185280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1287.20-1287.46"
  185281. }
  185282. },
  185283. "cpu_I.decode_to_execute_BRANCH_CTRL": {
  185284. "hide_name": 0,
  185285. "bits": [ 3968, 3967 ],
  185286. "attributes": {
  185287. "hdlname": "cpu_I decode_to_execute_BRANCH_CTRL",
  185288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1265.20-1265.49"
  185289. }
  185290. },
  185291. "cpu_I.decode_to_execute_BRANCH_CTRL_SB_LUT4_I2_O": {
  185292. "hide_name": 0,
  185293. "bits": [ 4250, 2771, 3969 ],
  185294. "attributes": {
  185295. "force_downto": "00000000000000000000000000000001",
  185296. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185297. }
  185298. },
  185299. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE": {
  185300. "hide_name": 0,
  185301. "bits": [ 3280 ],
  185302. "attributes": {
  185303. "hdlname": "cpu_I decode_to_execute_BYPASSABLE_EXECUTE_STAGE",
  185304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1297.23-1297.65"
  185305. }
  185306. },
  185307. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I2_1_O": {
  185308. "hide_name": 0,
  185309. "bits": [ 3841, 3865, 2963 ],
  185310. "attributes": {
  185311. "force_downto": "00000000000000000000000000000001",
  185312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185313. }
  185314. },
  185315. "cpu_I.decode_to_execute_BYPASSABLE_EXECUTE_STAGE_SB_LUT4_I2_O": {
  185316. "hide_name": 0,
  185317. "bits": [ 3708, 3709, 2970 ],
  185318. "attributes": {
  185319. "force_downto": "00000000000000000000000000000001",
  185320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185321. }
  185322. },
  185323. "cpu_I.decode_to_execute_BYPASSABLE_MEMORY_STAGE": {
  185324. "hide_name": 0,
  185325. "bits": [ 3974 ],
  185326. "attributes": {
  185327. "hdlname": "cpu_I decode_to_execute_BYPASSABLE_MEMORY_STAGE",
  185328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1288.23-1288.64"
  185329. }
  185330. },
  185331. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE": {
  185332. "hide_name": 0,
  185333. "bits": [ 3975 ],
  185334. "attributes": {
  185335. "hdlname": "cpu_I decode_to_execute_CSR_WRITE_OPCODE",
  185336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1285.23-1285.57"
  185337. }
  185338. },
  185339. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0_O": {
  185340. "hide_name": 0,
  185341. "bits": [ 1042, 1153 ],
  185342. "attributes": {
  185343. "force_downto": "00000000000000000000000000000001",
  185344. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185345. }
  185346. },
  185347. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0_O_SB_LUT4_I3_1_O": {
  185348. "hide_name": 0,
  185349. "bits": [ 2768, 1213, 2834 ],
  185350. "attributes": {
  185351. "force_downto": "00000000000000000000000000000001",
  185352. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185353. }
  185354. },
  185355. "cpu_I.decode_to_execute_CSR_WRITE_OPCODE_SB_LUT4_I0_O_SB_LUT4_I3_O": {
  185356. "hide_name": 0,
  185357. "bits": [ 1040 ],
  185358. "attributes": {
  185359. "defaultvalue": "1",
  185360. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4303.3-4561.6|/usr/bin/../share/yosys/ice40/ff_map.v:14.63-14.116|/usr/bin/../share/yosys/ice40/cells_sim.v:656.8-656.9"
  185361. }
  185362. },
  185363. "cpu_I.decode_to_execute_ENV_CTRL": {
  185364. "hide_name": 0,
  185365. "bits": [ 1240, 1239 ],
  185366. "attributes": {
  185367. "hdlname": "cpu_I decode_to_execute_ENV_CTRL",
  185368. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1294.20-1294.46"
  185369. }
  185370. },
  185371. "cpu_I.decode_to_execute_INSTRUCTION": {
  185372. "hide_name": 0,
  185373. "bits": [ 994, 992, 988, 986, 984, 982, 980, 978, 976, 974, 972, 970, 966, 964, 962, 960, 958, 956, 954, 952, 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  185374. "attributes": {
  185375. "hdlname": "cpu_I decode_to_execute_INSTRUCTION",
  185376. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1266.23-1266.52"
  185377. }
  185378. },
  185379. "cpu_I.decode_to_execute_IS_CSR": {
  185380. "hide_name": 0,
  185381. "bits": [ 3977 ],
  185382. "attributes": {
  185383. "hdlname": "cpu_I decode_to_execute_IS_CSR",
  185384. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1292.23-1292.47"
  185385. }
  185386. },
  185387. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_I3": {
  185388. "hide_name": 0,
  185389. "bits": [ 3977, 1241 ],
  185390. "attributes": {
  185391. "force_downto": "00000000000000000000000000000001",
  185392. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185393. }
  185394. },
  185395. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O": {
  185396. "hide_name": 0,
  185397. "bits": [ 2326, 3090, 2858, 3982 ],
  185398. "attributes": {
  185399. "force_downto": "00000000000000000000000000000001",
  185400. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185401. }
  185402. },
  185403. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_DFFR_Q_D": {
  185404. "hide_name": 0,
  185405. "bits": [ 3979 ],
  185406. "attributes": {
  185407. }
  185408. },
  185409. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_LUT4_O_I1": {
  185410. "hide_name": 0,
  185411. "bits": [ 3980, 3981, 1241, 1018 ],
  185412. "attributes": {
  185413. "force_downto": "00000000000000000000000000000001",
  185414. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185415. }
  185416. },
  185417. "cpu_I.decode_to_execute_IS_CSR_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_DFFS_Q_D": {
  185418. "hide_name": 0,
  185419. "bits": [ 3983 ],
  185420. "attributes": {
  185421. }
  185422. },
  185423. "cpu_I.decode_to_execute_IS_DIV": {
  185424. "hide_name": 0,
  185425. "bits": [ 3984 ],
  185426. "attributes": {
  185427. "hdlname": "cpu_I decode_to_execute_IS_DIV",
  185428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1276.23-1276.47"
  185429. }
  185430. },
  185431. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_1_O": {
  185432. "hide_name": 0,
  185433. "bits": [ 2770, 3987 ],
  185434. "attributes": {
  185435. "force_downto": "00000000000000000000000000000001",
  185436. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185437. }
  185438. },
  185439. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O": {
  185440. "hide_name": 0,
  185441. "bits": [ 2680, 1018, 3986, 3988 ],
  185442. "attributes": {
  185443. "force_downto": "00000000000000000000000000000001",
  185444. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185445. }
  185446. },
  185447. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_I3": {
  185448. "hide_name": 0,
  185449. "bits": [ 3988 ],
  185450. "attributes": {
  185451. "abc9_carry": "00000000000000000000000000000001",
  185452. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185453. }
  185454. },
  185455. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_I3_SB_CARRY_CO_CI": {
  185456. "hide_name": 0,
  185457. "bits": [ 3990 ],
  185458. "attributes": {
  185459. "abc9_carry": "00000000000000000000000000000001",
  185460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185461. }
  185462. },
  185463. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_I3_SB_CARRY_CO_I1": {
  185464. "hide_name": 0,
  185465. "bits": [ "0", "0", 3991, 3990 ],
  185466. "attributes": {
  185467. "force_downto": "00000000000000000000000000000001",
  185468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185469. }
  185470. },
  185471. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O": {
  185472. "hide_name": 0,
  185473. "bits": [ 4105, 3996, 4130, 4124, 4119, 4114, 4109, 4103, 4051, 3998, 4097, 4093, 4088, 4083, 4078, 4073, 4068, 4063, 4058, 4053, 4042, 4037, 4032, 4027, 4023, 4018, 4013, 4008, 4004, 4000, 4128, 3989 ],
  185474. "attributes": {
  185475. }
  185476. },
  185477. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10_I3": {
  185478. "hide_name": 0,
  185479. "bits": [ 2663, 1018, 3999 ],
  185480. "attributes": {
  185481. "force_downto": "00000000000000000000000000000001",
  185482. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185483. }
  185484. },
  185485. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_LUT4_O_I2": {
  185486. "hide_name": 0,
  185487. "bits": [ "0", "0", 3993, 3992 ],
  185488. "attributes": {
  185489. "force_downto": "00000000000000000000000000000001",
  185490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185491. }
  185492. },
  185493. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_10_I3_SB_LUT4_O_I3": {
  185494. "hide_name": 0,
  185495. "bits": [ 3992 ],
  185496. "attributes": {
  185497. "abc9_carry": "00000000000000000000000000000001",
  185498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185499. }
  185500. },
  185501. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11_I3": {
  185502. "hide_name": 0,
  185503. "bits": [ 2651, 1018, 4003 ],
  185504. "attributes": {
  185505. "force_downto": "00000000000000000000000000000001",
  185506. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185507. }
  185508. },
  185509. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_LUT4_O_I2": {
  185510. "hide_name": 0,
  185511. "bits": [ "0", "0", 4002, 4001 ],
  185512. "attributes": {
  185513. "force_downto": "00000000000000000000000000000001",
  185514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185515. }
  185516. },
  185517. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_11_I3_SB_LUT4_O_I3": {
  185518. "hide_name": 0,
  185519. "bits": [ 4001 ],
  185520. "attributes": {
  185521. "abc9_carry": "00000000000000000000000000000001",
  185522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185523. }
  185524. },
  185525. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12_I3": {
  185526. "hide_name": 0,
  185527. "bits": [ 2646, 1018, 4007 ],
  185528. "attributes": {
  185529. "force_downto": "00000000000000000000000000000001",
  185530. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185531. }
  185532. },
  185533. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_LUT4_O_I2": {
  185534. "hide_name": 0,
  185535. "bits": [ "0", "0", 4006, 4005 ],
  185536. "attributes": {
  185537. "force_downto": "00000000000000000000000000000001",
  185538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185539. }
  185540. },
  185541. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_12_I3_SB_LUT4_O_I3": {
  185542. "hide_name": 0,
  185543. "bits": [ 4005 ],
  185544. "attributes": {
  185545. "abc9_carry": "00000000000000000000000000000001",
  185546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185547. }
  185548. },
  185549. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13_I3": {
  185550. "hide_name": 0,
  185551. "bits": [ 2641, 1018, 4012 ],
  185552. "attributes": {
  185553. "force_downto": "00000000000000000000000000000001",
  185554. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185555. }
  185556. },
  185557. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_LUT4_O_I2": {
  185558. "hide_name": 0,
  185559. "bits": [ "0", "0", 4011, 4010 ],
  185560. "attributes": {
  185561. "force_downto": "00000000000000000000000000000001",
  185562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185563. }
  185564. },
  185565. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_13_I3_SB_LUT4_O_I3": {
  185566. "hide_name": 0,
  185567. "bits": [ 4010 ],
  185568. "attributes": {
  185569. "abc9_carry": "00000000000000000000000000000001",
  185570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185571. }
  185572. },
  185573. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14_I3": {
  185574. "hide_name": 0,
  185575. "bits": [ 2636, 1018, 4017 ],
  185576. "attributes": {
  185577. "force_downto": "00000000000000000000000000000001",
  185578. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185579. }
  185580. },
  185581. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_LUT4_O_I2": {
  185582. "hide_name": 0,
  185583. "bits": [ "0", "0", 4016, 4015 ],
  185584. "attributes": {
  185585. "force_downto": "00000000000000000000000000000001",
  185586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185587. }
  185588. },
  185589. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_14_I3_SB_LUT4_O_I3": {
  185590. "hide_name": 0,
  185591. "bits": [ 4015 ],
  185592. "attributes": {
  185593. "abc9_carry": "00000000000000000000000000000001",
  185594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185595. }
  185596. },
  185597. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15_I3": {
  185598. "hide_name": 0,
  185599. "bits": [ 2631, 1018, 4022 ],
  185600. "attributes": {
  185601. "force_downto": "00000000000000000000000000000001",
  185602. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185603. }
  185604. },
  185605. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15_I3_SB_LUT4_O_I2": {
  185606. "hide_name": 0,
  185607. "bits": [ "0", "0", 4021, 4020 ],
  185608. "attributes": {
  185609. "force_downto": "00000000000000000000000000000001",
  185610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185611. }
  185612. },
  185613. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_15_I3_SB_LUT4_O_I3": {
  185614. "hide_name": 0,
  185615. "bits": [ 4020 ],
  185616. "attributes": {
  185617. "abc9_carry": "00000000000000000000000000000001",
  185618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185619. }
  185620. },
  185621. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16_I3": {
  185622. "hide_name": 0,
  185623. "bits": [ 2626, 1018, 4026 ],
  185624. "attributes": {
  185625. "force_downto": "00000000000000000000000000000001",
  185626. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185627. }
  185628. },
  185629. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16_I3_SB_LUT4_O_I2": {
  185630. "hide_name": 0,
  185631. "bits": [ "0", "0", 4025, 4024 ],
  185632. "attributes": {
  185633. "force_downto": "00000000000000000000000000000001",
  185634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185635. }
  185636. },
  185637. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_16_I3_SB_LUT4_O_I3": {
  185638. "hide_name": 0,
  185639. "bits": [ 4024 ],
  185640. "attributes": {
  185641. "abc9_carry": "00000000000000000000000000000001",
  185642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185643. }
  185644. },
  185645. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17_I3": {
  185646. "hide_name": 0,
  185647. "bits": [ 2621, 1018, 4031 ],
  185648. "attributes": {
  185649. "force_downto": "00000000000000000000000000000001",
  185650. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185651. }
  185652. },
  185653. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17_I3_SB_LUT4_O_I2": {
  185654. "hide_name": 0,
  185655. "bits": [ "0", "0", 4030, 4029 ],
  185656. "attributes": {
  185657. "force_downto": "00000000000000000000000000000001",
  185658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185659. }
  185660. },
  185661. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_17_I3_SB_LUT4_O_I3": {
  185662. "hide_name": 0,
  185663. "bits": [ 4029 ],
  185664. "attributes": {
  185665. "abc9_carry": "00000000000000000000000000000001",
  185666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185667. }
  185668. },
  185669. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18_I3": {
  185670. "hide_name": 0,
  185671. "bits": [ 2616, 1018, 4036 ],
  185672. "attributes": {
  185673. "force_downto": "00000000000000000000000000000001",
  185674. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185675. }
  185676. },
  185677. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18_I3_SB_LUT4_O_I2": {
  185678. "hide_name": 0,
  185679. "bits": [ "0", "0", 4035, 4034 ],
  185680. "attributes": {
  185681. "force_downto": "00000000000000000000000000000001",
  185682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185683. }
  185684. },
  185685. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_18_I3_SB_LUT4_O_I3": {
  185686. "hide_name": 0,
  185687. "bits": [ 4034 ],
  185688. "attributes": {
  185689. "abc9_carry": "00000000000000000000000000000001",
  185690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185691. }
  185692. },
  185693. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19_I3": {
  185694. "hide_name": 0,
  185695. "bits": [ 2611, 1018, 4041 ],
  185696. "attributes": {
  185697. "force_downto": "00000000000000000000000000000001",
  185698. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185699. }
  185700. },
  185701. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19_I3_SB_LUT4_O_I2": {
  185702. "hide_name": 0,
  185703. "bits": [ "0", "0", 4040, 4039 ],
  185704. "attributes": {
  185705. "force_downto": "00000000000000000000000000000001",
  185706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185707. }
  185708. },
  185709. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_19_I3_SB_LUT4_O_I3": {
  185710. "hide_name": 0,
  185711. "bits": [ 4039 ],
  185712. "attributes": {
  185713. "abc9_carry": "00000000000000000000000000000001",
  185714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185715. }
  185716. },
  185717. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1_I2": {
  185718. "hide_name": 0,
  185719. "bits": [ 2718, 3997, 1018 ],
  185720. "attributes": {
  185721. "force_downto": "00000000000000000000000000000001",
  185722. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185723. }
  185724. },
  185725. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I2": {
  185726. "hide_name": 0,
  185727. "bits": [ "0", "0", 4045, 4046 ],
  185728. "attributes": {
  185729. "force_downto": "00000000000000000000000000000001",
  185730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185731. }
  185732. },
  185733. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_1_I2_SB_LUT4_O_I3": {
  185734. "hide_name": 0,
  185735. "bits": [ 4046 ],
  185736. "attributes": {
  185737. "abc9_carry": "00000000000000000000000000000001",
  185738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185739. }
  185740. },
  185741. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20_I3": {
  185742. "hide_name": 0,
  185743. "bits": [ 2603, 1018, 4052 ],
  185744. "attributes": {
  185745. "force_downto": "00000000000000000000000000000001",
  185746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185747. }
  185748. },
  185749. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20_I3_SB_LUT4_O_I2": {
  185750. "hide_name": 0,
  185751. "bits": [ "0", "0", 4044, 4043 ],
  185752. "attributes": {
  185753. "force_downto": "00000000000000000000000000000001",
  185754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185755. }
  185756. },
  185757. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_20_I3_SB_LUT4_O_I3": {
  185758. "hide_name": 0,
  185759. "bits": [ 4043 ],
  185760. "attributes": {
  185761. "abc9_carry": "00000000000000000000000000000001",
  185762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185763. }
  185764. },
  185765. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21_I3": {
  185766. "hide_name": 0,
  185767. "bits": [ 2750, 1018, 4057 ],
  185768. "attributes": {
  185769. "force_downto": "00000000000000000000000000000001",
  185770. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185771. }
  185772. },
  185773. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21_I3_SB_LUT4_O_I2": {
  185774. "hide_name": 0,
  185775. "bits": [ "0", "0", 4056, 4055 ],
  185776. "attributes": {
  185777. "force_downto": "00000000000000000000000000000001",
  185778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185779. }
  185780. },
  185781. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_21_I3_SB_LUT4_O_I3": {
  185782. "hide_name": 0,
  185783. "bits": [ 4055 ],
  185784. "attributes": {
  185785. "abc9_carry": "00000000000000000000000000000001",
  185786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185787. }
  185788. },
  185789. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22_I3": {
  185790. "hide_name": 0,
  185791. "bits": [ 2747, 1018, 4062 ],
  185792. "attributes": {
  185793. "force_downto": "00000000000000000000000000000001",
  185794. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185795. }
  185796. },
  185797. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22_I3_SB_LUT4_O_I2": {
  185798. "hide_name": 0,
  185799. "bits": [ "0", "0", 4061, 4060 ],
  185800. "attributes": {
  185801. "force_downto": "00000000000000000000000000000001",
  185802. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185803. }
  185804. },
  185805. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_22_I3_SB_LUT4_O_I3": {
  185806. "hide_name": 0,
  185807. "bits": [ 4060 ],
  185808. "attributes": {
  185809. "abc9_carry": "00000000000000000000000000000001",
  185810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185811. }
  185812. },
  185813. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23_I3": {
  185814. "hide_name": 0,
  185815. "bits": [ 2742, 1018, 4067 ],
  185816. "attributes": {
  185817. "force_downto": "00000000000000000000000000000001",
  185818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185819. }
  185820. },
  185821. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23_I3_SB_LUT4_O_I2": {
  185822. "hide_name": 0,
  185823. "bits": [ "0", "0", 4066, 4065 ],
  185824. "attributes": {
  185825. "force_downto": "00000000000000000000000000000001",
  185826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185827. }
  185828. },
  185829. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_23_I3_SB_LUT4_O_I3": {
  185830. "hide_name": 0,
  185831. "bits": [ 4065 ],
  185832. "attributes": {
  185833. "abc9_carry": "00000000000000000000000000000001",
  185834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185835. }
  185836. },
  185837. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24_I3": {
  185838. "hide_name": 0,
  185839. "bits": [ 2737, 1018, 4072 ],
  185840. "attributes": {
  185841. "force_downto": "00000000000000000000000000000001",
  185842. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185843. }
  185844. },
  185845. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24_I3_SB_LUT4_O_I2": {
  185846. "hide_name": 0,
  185847. "bits": [ "0", "0", 4071, 4070 ],
  185848. "attributes": {
  185849. "force_downto": "00000000000000000000000000000001",
  185850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185851. }
  185852. },
  185853. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_24_I3_SB_LUT4_O_I3": {
  185854. "hide_name": 0,
  185855. "bits": [ 4070 ],
  185856. "attributes": {
  185857. "abc9_carry": "00000000000000000000000000000001",
  185858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185859. }
  185860. },
  185861. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25_I3": {
  185862. "hide_name": 0,
  185863. "bits": [ 2732, 1018, 4077 ],
  185864. "attributes": {
  185865. "force_downto": "00000000000000000000000000000001",
  185866. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185867. }
  185868. },
  185869. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25_I3_SB_LUT4_O_I2": {
  185870. "hide_name": 0,
  185871. "bits": [ "0", "0", 4076, 4075 ],
  185872. "attributes": {
  185873. "force_downto": "00000000000000000000000000000001",
  185874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185875. }
  185876. },
  185877. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_25_I3_SB_LUT4_O_I3": {
  185878. "hide_name": 0,
  185879. "bits": [ 4075 ],
  185880. "attributes": {
  185881. "abc9_carry": "00000000000000000000000000000001",
  185882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185883. }
  185884. },
  185885. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26_I3": {
  185886. "hide_name": 0,
  185887. "bits": [ 2727, 1018, 4082 ],
  185888. "attributes": {
  185889. "force_downto": "00000000000000000000000000000001",
  185890. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185891. }
  185892. },
  185893. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26_I3_SB_LUT4_O_I2": {
  185894. "hide_name": 0,
  185895. "bits": [ "0", "0", 4081, 4080 ],
  185896. "attributes": {
  185897. "force_downto": "00000000000000000000000000000001",
  185898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185899. }
  185900. },
  185901. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_26_I3_SB_LUT4_O_I3": {
  185902. "hide_name": 0,
  185903. "bits": [ 4080 ],
  185904. "attributes": {
  185905. "abc9_carry": "00000000000000000000000000000001",
  185906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185907. }
  185908. },
  185909. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27_I2": {
  185910. "hide_name": 0,
  185911. "bits": [ 2722, 4087, 1018 ],
  185912. "attributes": {
  185913. "force_downto": "00000000000000000000000000000001",
  185914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185915. }
  185916. },
  185917. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27_I2_SB_LUT4_O_I2": {
  185918. "hide_name": 0,
  185919. "bits": [ "0", "0", 4086, 4085 ],
  185920. "attributes": {
  185921. "force_downto": "00000000000000000000000000000001",
  185922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185923. }
  185924. },
  185925. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_27_I2_SB_LUT4_O_I3": {
  185926. "hide_name": 0,
  185927. "bits": [ 4085 ],
  185928. "attributes": {
  185929. "abc9_carry": "00000000000000000000000000000001",
  185930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185931. }
  185932. },
  185933. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28_I2": {
  185934. "hide_name": 0,
  185935. "bits": [ 2712, 4092, 1018 ],
  185936. "attributes": {
  185937. "force_downto": "00000000000000000000000000000001",
  185938. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185939. }
  185940. },
  185941. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28_I2_SB_LUT4_O_I2": {
  185942. "hide_name": 0,
  185943. "bits": [ "0", "0", 4091, 4090 ],
  185944. "attributes": {
  185945. "force_downto": "00000000000000000000000000000001",
  185946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185947. }
  185948. },
  185949. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_28_I2_SB_LUT4_O_I3": {
  185950. "hide_name": 0,
  185951. "bits": [ 4090 ],
  185952. "attributes": {
  185953. "abc9_carry": "00000000000000000000000000000001",
  185954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185955. }
  185956. },
  185957. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29_I2": {
  185958. "hide_name": 0,
  185959. "bits": [ 2653, 4096, 1018 ],
  185960. "attributes": {
  185961. "force_downto": "00000000000000000000000000000001",
  185962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185963. }
  185964. },
  185965. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29_I2_SB_LUT4_O_I2": {
  185966. "hide_name": 0,
  185967. "bits": [ "0", "0", 4095, 4094 ],
  185968. "attributes": {
  185969. "force_downto": "00000000000000000000000000000001",
  185970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185971. }
  185972. },
  185973. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_29_I2_SB_LUT4_O_I3": {
  185974. "hide_name": 0,
  185975. "bits": [ 4094 ],
  185976. "attributes": {
  185977. "abc9_carry": "00000000000000000000000000000001",
  185978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  185979. }
  185980. },
  185981. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2_I2": {
  185982. "hide_name": 0,
  185983. "bits": [ 2710, 4050, 1018 ],
  185984. "attributes": {
  185985. "force_downto": "00000000000000000000000000000001",
  185986. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185987. }
  185988. },
  185989. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O_I2": {
  185990. "hide_name": 0,
  185991. "bits": [ "0", "0", 4049, 4048 ],
  185992. "attributes": {
  185993. "force_downto": "00000000000000000000000000000001",
  185994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  185995. }
  185996. },
  185997. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_2_I2_SB_LUT4_O_I3": {
  185998. "hide_name": 0,
  185999. "bits": [ 4048 ],
  186000. "attributes": {
  186001. "abc9_carry": "00000000000000000000000000000001",
  186002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186003. }
  186004. },
  186005. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3_I2": {
  186006. "hide_name": 0,
  186007. "bits": [ 2705, 4102, 1018 ],
  186008. "attributes": {
  186009. "force_downto": "00000000000000000000000000000001",
  186010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186011. }
  186012. },
  186013. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3_I2_SB_LUT4_O_I2": {
  186014. "hide_name": 0,
  186015. "bits": [ "0", "0", 4101, 4100 ],
  186016. "attributes": {
  186017. "force_downto": "00000000000000000000000000000001",
  186018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186019. }
  186020. },
  186021. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_3_I2_SB_LUT4_O_I3": {
  186022. "hide_name": 0,
  186023. "bits": [ 4100 ],
  186024. "attributes": {
  186025. "abc9_carry": "00000000000000000000000000000001",
  186026. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186027. }
  186028. },
  186029. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4_I2": {
  186030. "hide_name": 0,
  186031. "bits": [ 2700, 4108, 1018 ],
  186032. "attributes": {
  186033. "force_downto": "00000000000000000000000000000001",
  186034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186035. }
  186036. },
  186037. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4_I2_SB_LUT4_O_I2": {
  186038. "hide_name": 0,
  186039. "bits": [ "0", "0", 4107, 4106 ],
  186040. "attributes": {
  186041. "force_downto": "00000000000000000000000000000001",
  186042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186043. }
  186044. },
  186045. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_4_I2_SB_LUT4_O_I3": {
  186046. "hide_name": 0,
  186047. "bits": [ 4106 ],
  186048. "attributes": {
  186049. "abc9_carry": "00000000000000000000000000000001",
  186050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186051. }
  186052. },
  186053. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5_I2": {
  186054. "hide_name": 0,
  186055. "bits": [ 2695, 4113, 1018 ],
  186056. "attributes": {
  186057. "force_downto": "00000000000000000000000000000001",
  186058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186059. }
  186060. },
  186061. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5_I2_SB_LUT4_O_I2": {
  186062. "hide_name": 0,
  186063. "bits": [ "0", "0", 4112, 4111 ],
  186064. "attributes": {
  186065. "force_downto": "00000000000000000000000000000001",
  186066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186067. }
  186068. },
  186069. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_5_I2_SB_LUT4_O_I3": {
  186070. "hide_name": 0,
  186071. "bits": [ 4111 ],
  186072. "attributes": {
  186073. "abc9_carry": "00000000000000000000000000000001",
  186074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186075. }
  186076. },
  186077. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6_I2": {
  186078. "hide_name": 0,
  186079. "bits": [ 2690, 4118, 1018 ],
  186080. "attributes": {
  186081. "force_downto": "00000000000000000000000000000001",
  186082. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186083. }
  186084. },
  186085. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6_I2_SB_LUT4_O_I2": {
  186086. "hide_name": 0,
  186087. "bits": [ "0", "0", 4117, 4116 ],
  186088. "attributes": {
  186089. "force_downto": "00000000000000000000000000000001",
  186090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186091. }
  186092. },
  186093. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_6_I2_SB_LUT4_O_I3": {
  186094. "hide_name": 0,
  186095. "bits": [ 4116 ],
  186096. "attributes": {
  186097. "abc9_carry": "00000000000000000000000000000001",
  186098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186099. }
  186100. },
  186101. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7_I2": {
  186102. "hide_name": 0,
  186103. "bits": [ 2685, 4123, 1018 ],
  186104. "attributes": {
  186105. "force_downto": "00000000000000000000000000000001",
  186106. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186107. }
  186108. },
  186109. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7_I2_SB_LUT4_O_I2": {
  186110. "hide_name": 0,
  186111. "bits": [ "0", "0", 4122, 4121 ],
  186112. "attributes": {
  186113. "force_downto": "00000000000000000000000000000001",
  186114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186115. }
  186116. },
  186117. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_7_I2_SB_LUT4_O_I3": {
  186118. "hide_name": 0,
  186119. "bits": [ 4121 ],
  186120. "attributes": {
  186121. "abc9_carry": "00000000000000000000000000000001",
  186122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186123. }
  186124. },
  186125. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_8_I3": {
  186126. "hide_name": 0,
  186127. "bits": [ 2675, 1018, 4127 ],
  186128. "attributes": {
  186129. "force_downto": "00000000000000000000000000000001",
  186130. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186131. }
  186132. },
  186133. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2": {
  186134. "hide_name": 0,
  186135. "bits": [ 2668, 4129, 1018 ],
  186136. "attributes": {
  186137. "force_downto": "00000000000000000000000000000001",
  186138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186139. }
  186140. },
  186141. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I2": {
  186142. "hide_name": 0,
  186143. "bits": [ "0", "0", 4126, 4125 ],
  186144. "attributes": {
  186145. "force_downto": "00000000000000000000000000000001",
  186146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186147. }
  186148. },
  186149. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3": {
  186150. "hide_name": 0,
  186151. "bits": [ 4125 ],
  186152. "attributes": {
  186153. "abc9_carry": "00000000000000000000000000000001",
  186154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186155. }
  186156. },
  186157. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  186158. "hide_name": 0,
  186159. "bits": [ 4131 ],
  186160. "attributes": {
  186161. "abc9_carry": "00000000000000000000000000000001",
  186162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186163. }
  186164. },
  186165. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I1": {
  186166. "hide_name": 0,
  186167. "bits": [ 4133 ],
  186168. "attributes": {
  186169. }
  186170. },
  186171. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_I1": {
  186172. "hide_name": 0,
  186173. "bits": [ "0", "0", 4132, 4131 ],
  186174. "attributes": {
  186175. "force_downto": "00000000000000000000000000000001",
  186176. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4655.32-4655.79|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186177. }
  186178. },
  186179. "cpu_I.decode_to_execute_IS_DIV_SB_LUT4_I2_O_SB_LUT4_I2_O_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O": {
  186180. "hide_name": 0,
  186181. "bits": [ 2720, 3994, 3995 ],
  186182. "attributes": {
  186183. "force_downto": "00000000000000000000000000000001",
  186184. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186185. }
  186186. },
  186187. "cpu_I.decode_to_execute_IS_MUL": {
  186188. "hide_name": 0,
  186189. "bits": [ 4136 ],
  186190. "attributes": {
  186191. "hdlname": "cpu_I decode_to_execute_IS_MUL",
  186192. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1251.23-1251.47"
  186193. }
  186194. },
  186195. "cpu_I.decode_to_execute_IS_RS1_SIGNED": {
  186196. "hide_name": 0,
  186197. "bits": [ 3985 ],
  186198. "attributes": {
  186199. "hdlname": "cpu_I decode_to_execute_IS_RS1_SIGNED",
  186200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1305.23-1305.54"
  186201. }
  186202. },
  186203. "cpu_I.decode_to_execute_IS_RS2_SIGNED": {
  186204. "hide_name": 0,
  186205. "bits": [ 3985 ],
  186206. "attributes": {
  186207. "hdlname": "cpu_I decode_to_execute_IS_RS2_SIGNED",
  186208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1306.23-1306.54"
  186209. }
  186210. },
  186211. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_I3": {
  186212. "hide_name": 0,
  186213. "bits": [ 4137 ],
  186214. "attributes": {
  186215. "abc9_carry": "00000000000000000000000000000001",
  186216. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186217. }
  186218. },
  186219. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O": {
  186220. "hide_name": 0,
  186221. "bits": [ 3639, 4185, 4193, 4196, 4199, 4202, 4205, 4208, 4211, 4143, 4146, 4182, 4214, 4217, 4220, 4223, 4226, 4229, 4230, 4149, 4155, 4158, 4161, 4164, 4167, 4170, 4173, 4176, 4179, 4189, 4190, 4138 ],
  186222. "attributes": {
  186223. "force_downto": "00000000000000000000000000000001",
  186224. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  186225. }
  186226. },
  186227. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_10_I2": {
  186228. "hide_name": 0,
  186229. "bits": [ "0", "0", 4147, 4148 ],
  186230. "attributes": {
  186231. "force_downto": "00000000000000000000000000000001",
  186232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186233. }
  186234. },
  186235. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_10_I3": {
  186236. "hide_name": 0,
  186237. "bits": [ 4148 ],
  186238. "attributes": {
  186239. "abc9_carry": "00000000000000000000000000000001",
  186240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186241. }
  186242. },
  186243. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_11_I2": {
  186244. "hide_name": 0,
  186245. "bits": [ "0", "0", 4153, 4154 ],
  186246. "attributes": {
  186247. "force_downto": "00000000000000000000000000000001",
  186248. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186249. }
  186250. },
  186251. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_11_I3": {
  186252. "hide_name": 0,
  186253. "bits": [ 4154 ],
  186254. "attributes": {
  186255. "abc9_carry": "00000000000000000000000000000001",
  186256. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186257. }
  186258. },
  186259. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_12_I2": {
  186260. "hide_name": 0,
  186261. "bits": [ "0", "0", 4156, 4157 ],
  186262. "attributes": {
  186263. "force_downto": "00000000000000000000000000000001",
  186264. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186265. }
  186266. },
  186267. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_12_I3": {
  186268. "hide_name": 0,
  186269. "bits": [ 4157 ],
  186270. "attributes": {
  186271. "abc9_carry": "00000000000000000000000000000001",
  186272. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186273. }
  186274. },
  186275. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_13_I2": {
  186276. "hide_name": 0,
  186277. "bits": [ "0", "0", 4159, 4160 ],
  186278. "attributes": {
  186279. "force_downto": "00000000000000000000000000000001",
  186280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186281. }
  186282. },
  186283. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_13_I3": {
  186284. "hide_name": 0,
  186285. "bits": [ 4160 ],
  186286. "attributes": {
  186287. "abc9_carry": "00000000000000000000000000000001",
  186288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186289. }
  186290. },
  186291. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_14_I2": {
  186292. "hide_name": 0,
  186293. "bits": [ "0", "0", 4162, 4163 ],
  186294. "attributes": {
  186295. "force_downto": "00000000000000000000000000000001",
  186296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186297. }
  186298. },
  186299. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_14_I3": {
  186300. "hide_name": 0,
  186301. "bits": [ 4163 ],
  186302. "attributes": {
  186303. "abc9_carry": "00000000000000000000000000000001",
  186304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186305. }
  186306. },
  186307. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_15_I2": {
  186308. "hide_name": 0,
  186309. "bits": [ "0", "0", 4165, 4166 ],
  186310. "attributes": {
  186311. "force_downto": "00000000000000000000000000000001",
  186312. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186313. }
  186314. },
  186315. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_15_I3": {
  186316. "hide_name": 0,
  186317. "bits": [ 4166 ],
  186318. "attributes": {
  186319. "abc9_carry": "00000000000000000000000000000001",
  186320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186321. }
  186322. },
  186323. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_16_I2": {
  186324. "hide_name": 0,
  186325. "bits": [ "0", "0", 4168, 4169 ],
  186326. "attributes": {
  186327. "force_downto": "00000000000000000000000000000001",
  186328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186329. }
  186330. },
  186331. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_16_I3": {
  186332. "hide_name": 0,
  186333. "bits": [ 4169 ],
  186334. "attributes": {
  186335. "abc9_carry": "00000000000000000000000000000001",
  186336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186337. }
  186338. },
  186339. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_17_I2": {
  186340. "hide_name": 0,
  186341. "bits": [ "0", "0", 4171, 4172 ],
  186342. "attributes": {
  186343. "force_downto": "00000000000000000000000000000001",
  186344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186345. }
  186346. },
  186347. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_17_I3": {
  186348. "hide_name": 0,
  186349. "bits": [ 4172 ],
  186350. "attributes": {
  186351. "abc9_carry": "00000000000000000000000000000001",
  186352. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186353. }
  186354. },
  186355. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_18_I2": {
  186356. "hide_name": 0,
  186357. "bits": [ "0", "0", 4174, 4175 ],
  186358. "attributes": {
  186359. "force_downto": "00000000000000000000000000000001",
  186360. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186361. }
  186362. },
  186363. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_18_I3": {
  186364. "hide_name": 0,
  186365. "bits": [ 4175 ],
  186366. "attributes": {
  186367. "abc9_carry": "00000000000000000000000000000001",
  186368. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186369. }
  186370. },
  186371. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_19_I2": {
  186372. "hide_name": 0,
  186373. "bits": [ "0", "0", 4177, 4178 ],
  186374. "attributes": {
  186375. "force_downto": "00000000000000000000000000000001",
  186376. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186377. }
  186378. },
  186379. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_19_I3": {
  186380. "hide_name": 0,
  186381. "bits": [ 4178 ],
  186382. "attributes": {
  186383. "abc9_carry": "00000000000000000000000000000001",
  186384. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186385. }
  186386. },
  186387. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_1_I2": {
  186388. "hide_name": 0,
  186389. "bits": [ "0", "0", 4144, 4145 ],
  186390. "attributes": {
  186391. "force_downto": "00000000000000000000000000000001",
  186392. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186393. }
  186394. },
  186395. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_1_I3": {
  186396. "hide_name": 0,
  186397. "bits": [ 4145 ],
  186398. "attributes": {
  186399. "abc9_carry": "00000000000000000000000000000001",
  186400. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186401. }
  186402. },
  186403. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20_I2": {
  186404. "hide_name": 0,
  186405. "bits": [ "0", "0", 4183, 4184 ],
  186406. "attributes": {
  186407. "force_downto": "00000000000000000000000000000001",
  186408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186409. }
  186410. },
  186411. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20_I3": {
  186412. "hide_name": 0,
  186413. "bits": [ 4184 ],
  186414. "attributes": {
  186415. "abc9_carry": "00000000000000000000000000000001",
  186416. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186417. }
  186418. },
  186419. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_20_I3_SB_CARRY_CO_I1": {
  186420. "hide_name": 0,
  186421. "bits": [ 4186 ],
  186422. "attributes": {
  186423. }
  186424. },
  186425. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_21_I2": {
  186426. "hide_name": 0,
  186427. "bits": [ "0", "0", 4187, 4188 ],
  186428. "attributes": {
  186429. "force_downto": "00000000000000000000000000000001",
  186430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186431. }
  186432. },
  186433. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_21_I3": {
  186434. "hide_name": 0,
  186435. "bits": [ 4188 ],
  186436. "attributes": {
  186437. "abc9_carry": "00000000000000000000000000000001",
  186438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186439. }
  186440. },
  186441. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_22_I2": {
  186442. "hide_name": 0,
  186443. "bits": [ "0", "0", 4140, 4139 ],
  186444. "attributes": {
  186445. "force_downto": "00000000000000000000000000000001",
  186446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186447. }
  186448. },
  186449. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_22_I3": {
  186450. "hide_name": 0,
  186451. "bits": [ 4139 ],
  186452. "attributes": {
  186453. "abc9_carry": "00000000000000000000000000000001",
  186454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186455. }
  186456. },
  186457. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_23_I2": {
  186458. "hide_name": 0,
  186459. "bits": [ "0", "0", 4191, 4192 ],
  186460. "attributes": {
  186461. "force_downto": "00000000000000000000000000000001",
  186462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186463. }
  186464. },
  186465. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_23_I3": {
  186466. "hide_name": 0,
  186467. "bits": [ 4192 ],
  186468. "attributes": {
  186469. "abc9_carry": "00000000000000000000000000000001",
  186470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186471. }
  186472. },
  186473. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_24_I2": {
  186474. "hide_name": 0,
  186475. "bits": [ "0", "0", 4194, 4195 ],
  186476. "attributes": {
  186477. "force_downto": "00000000000000000000000000000001",
  186478. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186479. }
  186480. },
  186481. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_24_I3": {
  186482. "hide_name": 0,
  186483. "bits": [ 4195 ],
  186484. "attributes": {
  186485. "abc9_carry": "00000000000000000000000000000001",
  186486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186487. }
  186488. },
  186489. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_25_I2": {
  186490. "hide_name": 0,
  186491. "bits": [ "0", "0", 4197, 4198 ],
  186492. "attributes": {
  186493. "force_downto": "00000000000000000000000000000001",
  186494. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186495. }
  186496. },
  186497. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_25_I3": {
  186498. "hide_name": 0,
  186499. "bits": [ 4198 ],
  186500. "attributes": {
  186501. "abc9_carry": "00000000000000000000000000000001",
  186502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186503. }
  186504. },
  186505. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_26_I2": {
  186506. "hide_name": 0,
  186507. "bits": [ "0", "0", 4200, 4201 ],
  186508. "attributes": {
  186509. "force_downto": "00000000000000000000000000000001",
  186510. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186511. }
  186512. },
  186513. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_26_I3": {
  186514. "hide_name": 0,
  186515. "bits": [ 4201 ],
  186516. "attributes": {
  186517. "abc9_carry": "00000000000000000000000000000001",
  186518. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186519. }
  186520. },
  186521. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_27_I2": {
  186522. "hide_name": 0,
  186523. "bits": [ "0", "0", 4203, 4204 ],
  186524. "attributes": {
  186525. "force_downto": "00000000000000000000000000000001",
  186526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186527. }
  186528. },
  186529. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_27_I3": {
  186530. "hide_name": 0,
  186531. "bits": [ 4204 ],
  186532. "attributes": {
  186533. "abc9_carry": "00000000000000000000000000000001",
  186534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186535. }
  186536. },
  186537. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_28_I2": {
  186538. "hide_name": 0,
  186539. "bits": [ "0", "0", 4206, 4207 ],
  186540. "attributes": {
  186541. "force_downto": "00000000000000000000000000000001",
  186542. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186543. }
  186544. },
  186545. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_28_I3": {
  186546. "hide_name": 0,
  186547. "bits": [ 4207 ],
  186548. "attributes": {
  186549. "abc9_carry": "00000000000000000000000000000001",
  186550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186551. }
  186552. },
  186553. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_29_I2": {
  186554. "hide_name": 0,
  186555. "bits": [ "0", "0", 4209, 4210 ],
  186556. "attributes": {
  186557. "force_downto": "00000000000000000000000000000001",
  186558. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186559. }
  186560. },
  186561. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_29_I3": {
  186562. "hide_name": 0,
  186563. "bits": [ 4210 ],
  186564. "attributes": {
  186565. "abc9_carry": "00000000000000000000000000000001",
  186566. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186567. }
  186568. },
  186569. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_2_I2": {
  186570. "hide_name": 0,
  186571. "bits": [ "0", "0", 4180, 4181 ],
  186572. "attributes": {
  186573. "force_downto": "00000000000000000000000000000001",
  186574. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186575. }
  186576. },
  186577. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_2_I3": {
  186578. "hide_name": 0,
  186579. "bits": [ 4181 ],
  186580. "attributes": {
  186581. "abc9_carry": "00000000000000000000000000000001",
  186582. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186583. }
  186584. },
  186585. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_3_I2": {
  186586. "hide_name": 0,
  186587. "bits": [ "0", "0", 4212, 4213 ],
  186588. "attributes": {
  186589. "force_downto": "00000000000000000000000000000001",
  186590. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186591. }
  186592. },
  186593. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_3_I3": {
  186594. "hide_name": 0,
  186595. "bits": [ 4213 ],
  186596. "attributes": {
  186597. "abc9_carry": "00000000000000000000000000000001",
  186598. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186599. }
  186600. },
  186601. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_4_I2": {
  186602. "hide_name": 0,
  186603. "bits": [ "0", "0", 4215, 4216 ],
  186604. "attributes": {
  186605. "force_downto": "00000000000000000000000000000001",
  186606. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186607. }
  186608. },
  186609. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_4_I3": {
  186610. "hide_name": 0,
  186611. "bits": [ 4216 ],
  186612. "attributes": {
  186613. "abc9_carry": "00000000000000000000000000000001",
  186614. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186615. }
  186616. },
  186617. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_5_I2": {
  186618. "hide_name": 0,
  186619. "bits": [ "0", "0", 4218, 4219 ],
  186620. "attributes": {
  186621. "force_downto": "00000000000000000000000000000001",
  186622. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186623. }
  186624. },
  186625. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_5_I3": {
  186626. "hide_name": 0,
  186627. "bits": [ 4219 ],
  186628. "attributes": {
  186629. "abc9_carry": "00000000000000000000000000000001",
  186630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186631. }
  186632. },
  186633. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_6_I2": {
  186634. "hide_name": 0,
  186635. "bits": [ "0", "0", 4221, 4222 ],
  186636. "attributes": {
  186637. "force_downto": "00000000000000000000000000000001",
  186638. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186639. }
  186640. },
  186641. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_6_I3": {
  186642. "hide_name": 0,
  186643. "bits": [ 4222 ],
  186644. "attributes": {
  186645. "abc9_carry": "00000000000000000000000000000001",
  186646. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186647. }
  186648. },
  186649. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_7_I2": {
  186650. "hide_name": 0,
  186651. "bits": [ "0", "0", 4224, 4225 ],
  186652. "attributes": {
  186653. "force_downto": "00000000000000000000000000000001",
  186654. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186655. }
  186656. },
  186657. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_7_I3": {
  186658. "hide_name": 0,
  186659. "bits": [ 4225 ],
  186660. "attributes": {
  186661. "abc9_carry": "00000000000000000000000000000001",
  186662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186663. }
  186664. },
  186665. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_8_I2": {
  186666. "hide_name": 0,
  186667. "bits": [ "0", "0", 4227, 4228 ],
  186668. "attributes": {
  186669. "force_downto": "00000000000000000000000000000001",
  186670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186671. }
  186672. },
  186673. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_8_I3": {
  186674. "hide_name": 0,
  186675. "bits": [ 4228 ],
  186676. "attributes": {
  186677. "abc9_carry": "00000000000000000000000000000001",
  186678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186679. }
  186680. },
  186681. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_9_I2": {
  186682. "hide_name": 0,
  186683. "bits": [ "0", "0", 4152, 4151 ],
  186684. "attributes": {
  186685. "force_downto": "00000000000000000000000000000001",
  186686. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186687. }
  186688. },
  186689. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_9_I3": {
  186690. "hide_name": 0,
  186691. "bits": [ 4151 ],
  186692. "attributes": {
  186693. "abc9_carry": "00000000000000000000000000000001",
  186694. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186695. }
  186696. },
  186697. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_I2": {
  186698. "hide_name": 0,
  186699. "bits": [ "0", "0", 4141, 4142 ],
  186700. "attributes": {
  186701. "force_downto": "00000000000000000000000000000001",
  186702. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186703. }
  186704. },
  186705. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I1_O_SB_LUT4_O_I3": {
  186706. "hide_name": 0,
  186707. "bits": [ 4142 ],
  186708. "attributes": {
  186709. "abc9_carry": "00000000000000000000000000000001",
  186710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4656.32-4656.85|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  186711. }
  186712. },
  186713. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_I3": {
  186714. "hide_name": 0,
  186715. "bits": [ 3639, 3985, 4231 ],
  186716. "attributes": {
  186717. "force_downto": "00000000000000000000000000000001",
  186718. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186719. }
  186720. },
  186721. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O": {
  186722. "hide_name": 0,
  186723. "bits": [ 4232, 4235, 4242, 4239 ],
  186724. "attributes": {
  186725. "force_downto": "00000000000000000000000000000001",
  186726. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186727. }
  186728. },
  186729. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_1_I1": {
  186730. "hide_name": 0,
  186731. "bits": [ 4236, 4237, 4238 ],
  186732. "attributes": {
  186733. "force_downto": "00000000000000000000000000000001",
  186734. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186735. }
  186736. },
  186737. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_2_I2": {
  186738. "hide_name": 0,
  186739. "bits": [ 4240, 4241 ],
  186740. "attributes": {
  186741. "force_downto": "00000000000000000000000000000001",
  186742. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186743. }
  186744. },
  186745. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I2_O_SB_LUT4_O_I2": {
  186746. "hide_name": 0,
  186747. "bits": [ 4233, 4234 ],
  186748. "attributes": {
  186749. "force_downto": "00000000000000000000000000000001",
  186750. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186751. }
  186752. },
  186753. "cpu_I.decode_to_execute_IS_RS2_SIGNED_SB_LUT4_I3_O": {
  186754. "hide_name": 0,
  186755. "bits": [ 3674, 4150 ],
  186756. "attributes": {
  186757. "force_downto": "00000000000000000000000000000001",
  186758. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186759. }
  186760. },
  186761. "cpu_I.decode_to_execute_MEMORY_ENABLE": {
  186762. "hide_name": 0,
  186763. "bits": [ 3980 ],
  186764. "attributes": {
  186765. "hdlname": "cpu_I decode_to_execute_MEMORY_ENABLE",
  186766. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1248.23-1248.54"
  186767. }
  186768. },
  186769. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3": {
  186770. "hide_name": 0,
  186771. "bits": [ 944, 4243 ],
  186772. "attributes": {
  186773. "force_downto": "00000000000000000000000000000001",
  186774. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186775. }
  186776. },
  186777. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O": {
  186778. "hide_name": 0,
  186779. "bits": [ 1241, 1020, 1469 ],
  186780. "attributes": {
  186781. "force_downto": "00000000000000000000000000000001",
  186782. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186783. }
  186784. },
  186785. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_I3": {
  186786. "hide_name": 0,
  186787. "bits": [ 1469, 4244 ],
  186788. "attributes": {
  186789. "force_downto": "00000000000000000000000000000001",
  186790. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186791. }
  186792. },
  186793. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  186794. "hide_name": 0,
  186795. "bits": [ 3978 ],
  186796. "attributes": {
  186797. }
  186798. },
  186799. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O": {
  186800. "hide_name": 0,
  186801. "bits": [ 1018, 1023, 4245 ],
  186802. "attributes": {
  186803. "force_downto": "00000000000000000000000000000001",
  186804. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186805. }
  186806. },
  186807. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  186808. "hide_name": 0,
  186809. "bits": [ 4246 ],
  186810. "attributes": {
  186811. }
  186812. },
  186813. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_DFFR_D_Q": {
  186814. "hide_name": 0,
  186815. "bits": [ 4908, 3090 ],
  186816. "attributes": {
  186817. "force_downto": "00000000000000000000000000000001",
  186818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186819. }
  186820. },
  186821. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_1_O_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_DFFR_D_Q_SB_LUT4_I1_O": {
  186822. "hide_name": 0,
  186823. "bits": [ 2263 ],
  186824. "attributes": {
  186825. }
  186826. },
  186827. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O": {
  186828. "hide_name": 0,
  186829. "bits": [ 4247, 1020, 1478 ],
  186830. "attributes": {
  186831. "force_downto": "00000000000000000000000000000001",
  186832. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186833. }
  186834. },
  186835. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I1_O": {
  186836. "hide_name": 0,
  186837. "bits": [ 4248 ],
  186838. "attributes": {
  186839. }
  186840. },
  186841. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I1_O_SB_DFFR_D_Q": {
  186842. "hide_name": 0,
  186843. "bits": [ 1008, 1022, 1024 ],
  186844. "attributes": {
  186845. "force_downto": "00000000000000000000000000000001",
  186846. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186847. }
  186848. },
  186849. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_I3_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  186850. "hide_name": 0,
  186851. "bits": [ 1012 ],
  186852. "attributes": {
  186853. }
  186854. },
  186855. "cpu_I.decode_to_execute_MEMORY_ENABLE_SB_LUT4_I0_O": {
  186856. "hide_name": 0,
  186857. "bits": [ 914, 740, 937, 941 ],
  186858. "attributes": {
  186859. "force_downto": "00000000000000000000000000000001",
  186860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186861. }
  186862. },
  186863. "cpu_I.decode_to_execute_MEMORY_STORE": {
  186864. "hide_name": 0,
  186865. "bits": [ 982 ],
  186866. "attributes": {
  186867. "hdlname": "cpu_I decode_to_execute_MEMORY_STORE",
  186868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1245.23-1245.53"
  186869. }
  186870. },
  186871. "cpu_I.decode_to_execute_PC": {
  186872. "hide_name": 0,
  186873. "bits": [ "0", "0", 4261, 4260, 4259, 3014, 3034, 3045, 3059, 4258, 3074, 2867, 2880, 4256, 2896, 4255, 2911, 4254, 4253, 4252, 2932, 4251, 4266, 2952, 4265, 4264, 4263, 4262, 2994, 4257, 4250, 4249 ],
  186874. "attributes": {
  186875. "hdlname": "cpu_I decode_to_execute_PC",
  186876. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1282.23-1282.43"
  186877. }
  186878. },
  186879. "cpu_I.decode_to_execute_PREDICTION_HAD_BRANCHED2": {
  186880. "hide_name": 0,
  186881. "bits": [ 4267 ],
  186882. "attributes": {
  186883. "hdlname": "cpu_I decode_to_execute_PREDICTION_HAD_BRANCHED2",
  186884. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1244.23-1244.65"
  186885. }
  186886. },
  186887. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID": {
  186888. "hide_name": 0,
  186889. "bits": [ 4268 ],
  186890. "attributes": {
  186891. "hdlname": "cpu_I decode_to_execute_REGFILE_WRITE_VALID",
  186892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1279.23-1279.60"
  186893. }
  186894. },
  186895. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_DFFESR_Q_R": {
  186896. "hide_name": 0,
  186897. "bits": [ 2855 ],
  186898. "attributes": {
  186899. }
  186900. },
  186901. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_1_O": {
  186902. "hide_name": 0,
  186903. "bits": [ 1534, 976, 4271, 4270 ],
  186904. "attributes": {
  186905. "force_downto": "00000000000000000000000000000001",
  186906. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186907. }
  186908. },
  186909. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_O": {
  186910. "hide_name": 0,
  186911. "bits": [ 4275, 4276, 4269, 4274 ],
  186912. "attributes": {
  186913. "force_downto": "00000000000000000000000000000001",
  186914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186915. }
  186916. },
  186917. "cpu_I.decode_to_execute_REGFILE_WRITE_VALID_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  186918. "hide_name": 0,
  186919. "bits": [ 1549, 970, 4273 ],
  186920. "attributes": {
  186921. "force_downto": "00000000000000000000000000000001",
  186922. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186923. }
  186924. },
  186925. "cpu_I.decode_to_execute_RS1": {
  186926. "hide_name": 0,
  186927. "bits": [ 2842, 2770, 2759, 2848, 4120, 4115, 4110, 2846, 4099, 4047, 4098, 2852, 4089, 4084, 4079, 4074, 4069, 4064, 4059, 4054, 2851, 4038, 4033, 4028, 2845, 4019, 4014, 4009, 2849, 2756, 2771, 2843 ],
  186928. "attributes": {
  186929. "hdlname": "cpu_I decode_to_execute_RS1",
  186930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1243.23-1243.44"
  186931. }
  186932. },
  186933. "cpu_I.decode_to_execute_RS2": {
  186934. "hide_name": 0,
  186935. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3061, 3641, 3076, 2870, 2882, 3657, 2898, 3664, 2913, 3676, 3674, 3672, 2934, 3668, 3666, 2954, 3684, 3016, 3643, 3647, 2996, 3654, 3658, 3661 ],
  186936. "attributes": {
  186937. "hdlname": "cpu_I decode_to_execute_RS2",
  186938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1301.23-1301.44"
  186939. }
  186940. },
  186941. "cpu_I.decode_to_execute_SHIFT_CTRL": {
  186942. "hide_name": 0,
  186943. "bits": [ 4278, 4277 ],
  186944. "attributes": {
  186945. "hdlname": "cpu_I decode_to_execute_SHIFT_CTRL",
  186946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1273.20-1273.48"
  186947. }
  186948. },
  186949. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_LUT4_I1_O": {
  186950. "hide_name": 0,
  186951. "bits": [ 2359, 2410, 2562 ],
  186952. "attributes": {
  186953. "force_downto": "00000000000000000000000000000001",
  186954. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186955. }
  186956. },
  186957. "cpu_I.decode_to_execute_SHIFT_CTRL_SB_LUT4_I2_O": {
  186958. "hide_name": 0,
  186959. "bits": [ 2378, 2379, 2380 ],
  186960. "attributes": {
  186961. "force_downto": "00000000000000000000000000000001",
  186962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  186963. }
  186964. },
  186965. "cpu_I.decode_to_execute_SRC1_CTRL": {
  186966. "hide_name": 0,
  186967. "bits": [ 2758, 2757 ],
  186968. "attributes": {
  186969. "hdlname": "cpu_I decode_to_execute_SRC1_CTRL",
  186970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1302.20-1302.47"
  186971. }
  186972. },
  186973. "cpu_I.decode_to_execute_SRC2_CTRL": {
  186974. "hide_name": 0,
  186975. "bits": [ 2872, 2871 ],
  186976. "attributes": {
  186977. "hdlname": "cpu_I decode_to_execute_SRC2_CTRL",
  186978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1307.20-1307.47"
  186979. }
  186980. },
  186981. "cpu_I.decode_to_execute_SRC2_FORCE_ZERO": {
  186982. "hide_name": 0,
  186983. "bits": [ 1254 ],
  186984. "attributes": {
  186985. "hdlname": "cpu_I decode_to_execute_SRC2_FORCE_ZERO",
  186986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1255.23-1255.56"
  186987. }
  186988. },
  186989. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED": {
  186990. "hide_name": 0,
  186991. "bits": [ 4279 ],
  186992. "attributes": {
  186993. "hdlname": "cpu_I decode_to_execute_SRC_LESS_UNSIGNED",
  186994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1286.23-1286.58"
  186995. }
  186996. },
  186997. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1_I3": {
  186998. "hide_name": 0,
  186999. "bits": [ 4279, 1251, 1252 ],
  187000. "attributes": {
  187001. "force_downto": "00000000000000000000000000000001",
  187002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187003. }
  187004. },
  187005. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1_I3_SB_LUT4_O_I3": {
  187006. "hide_name": 0,
  187007. "bits": [ 4249, 2868, 4280 ],
  187008. "attributes": {
  187009. "force_downto": "00000000000000000000000000000001",
  187010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187011. }
  187012. },
  187013. "cpu_I.decode_to_execute_SRC_LESS_UNSIGNED_SB_LUT4_I1_O": {
  187014. "hide_name": 0,
  187015. "bits": [ 1246, 1247, 2778, 2779 ],
  187016. "attributes": {
  187017. "force_downto": "00000000000000000000000000000001",
  187018. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187019. }
  187020. },
  187021. "cpu_I.decode_to_execute_SRC_USE_SUB_LESS": {
  187022. "hide_name": 0,
  187023. "bits": [ 2991 ],
  187024. "attributes": {
  187025. "hdlname": "cpu_I decode_to_execute_SRC_USE_SUB_LESS",
  187026. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1264.23-1264.57"
  187027. }
  187028. },
  187029. "cpu_I.execute_ALIGNEMENT_FAULT": {
  187030. "hide_name": 0,
  187031. "bits": [ "0" ],
  187032. "attributes": {
  187033. "hdlname": "cpu_I execute_ALIGNEMENT_FAULT",
  187034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:842.23-842.47"
  187035. }
  187036. },
  187037. "cpu_I.execute_ALU_BITWISE_CTRL": {
  187038. "hide_name": 0,
  187039. "bits": [ 1250, 966 ],
  187040. "attributes": {
  187041. "hdlname": "cpu_I execute_ALU_BITWISE_CTRL",
  187042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:798.20-798.44"
  187043. }
  187044. },
  187045. "cpu_I.execute_ALU_CTRL": {
  187046. "hide_name": 0,
  187047. "bits": [ 1247, 1246 ],
  187048. "attributes": {
  187049. "hdlname": "cpu_I execute_ALU_CTRL",
  187050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:794.20-794.36"
  187051. }
  187052. },
  187053. "cpu_I.execute_BRANCH_CALC": {
  187054. "hide_name": 0,
  187055. "bits": [ "0", 7129, 4370, 4380, 4384, 4388, 4392, 4396, 4397, 4312, 4358, 4401, 4407, 4412, 4417, 4422, 4427, 4429, 4316, 4324, 4328, 4331, 4334, 4337, 4340, 4343, 4346, 4349, 4361, 4364, 4366, 4308 ],
  187056. "attributes": {
  187057. "hdlname": "cpu_I execute_BRANCH_CALC",
  187058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:697.23-697.42",
  187059. "unused_bits": "1 "
  187060. }
  187061. },
  187062. "cpu_I.execute_BRANCH_CTRL": {
  187063. "hide_name": 0,
  187064. "bits": [ 3968, 3967 ],
  187065. "attributes": {
  187066. "hdlname": "cpu_I execute_BRANCH_CTRL",
  187067. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:763.20-763.39"
  187068. }
  187069. },
  187070. "cpu_I.execute_BRANCH_DO": {
  187071. "hide_name": 0,
  187072. "bits": [ 4284 ],
  187073. "attributes": {
  187074. "hdlname": "cpu_I execute_BRANCH_DO",
  187075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:686.23-686.40"
  187076. }
  187077. },
  187078. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2": {
  187079. "hide_name": 0,
  187080. "bits": [ 3967, 4267, 4282, 4283 ],
  187081. "attributes": {
  187082. "force_downto": "00000000000000000000000000000001",
  187083. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187084. }
  187085. },
  187086. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0": {
  187087. "hide_name": 0,
  187088. "bits": [ 3968, 4286, 4290 ],
  187089. "attributes": {
  187090. "force_downto": "00000000000000000000000000000001",
  187091. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187092. }
  187093. },
  187094. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_I3": {
  187095. "hide_name": 0,
  187096. "bits": [ 962, 4302, 4290 ],
  187097. "attributes": {
  187098. "force_downto": "00000000000000000000000000000001",
  187099. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187100. }
  187101. },
  187102. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_I3_SB_LUT4_O_I1": {
  187103. "hide_name": 0,
  187104. "bits": [ 2781, 4291, 4292, 4293 ],
  187105. "attributes": {
  187106. "force_downto": "00000000000000000000000000000001",
  187107. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187108. }
  187109. },
  187110. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O": {
  187111. "hide_name": 0,
  187112. "bits": [ 4286, 4287, 4288, 4289 ],
  187113. "attributes": {
  187114. "force_downto": "00000000000000000000000000000001",
  187115. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187116. }
  187117. },
  187118. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_I0": {
  187119. "hide_name": 0,
  187120. "bits": [ 4301, 4302, 2778, 2779 ],
  187121. "attributes": {
  187122. "force_downto": "00000000000000000000000000000001",
  187123. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187124. }
  187125. },
  187126. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_I1": {
  187127. "hide_name": 0,
  187128. "bits": [ 3661, 4302 ],
  187129. "attributes": {
  187130. "force_downto": "00000000000000000000000000000001",
  187131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187132. }
  187133. },
  187134. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_1_I0_SB_LUT4_I2_O_SB_LUT4_O_I1_SB_LUT4_I3_O": {
  187135. "hide_name": 0,
  187136. "bits": [ 4303 ],
  187137. "attributes": {
  187138. "abc9_carry": "00000000000000000000000000000001",
  187139. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  187140. }
  187141. },
  187142. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  187143. "hide_name": 0,
  187144. "bits": [ 948, 2770, 3969, 4285 ],
  187145. "attributes": {
  187146. "force_downto": "00000000000000000000000000000001",
  187147. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187148. }
  187149. },
  187150. "cpu_I.execute_BRANCH_DO_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  187151. "hide_name": 0,
  187152. "bits": [ 948, 3967, 3968, 4304 ],
  187153. "attributes": {
  187154. "force_downto": "00000000000000000000000000000001",
  187155. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187156. }
  187157. },
  187158. "cpu_I.execute_BYPASSABLE_EXECUTE_STAGE": {
  187159. "hide_name": 0,
  187160. "bits": [ 3280 ],
  187161. "attributes": {
  187162. "hdlname": "cpu_I execute_BYPASSABLE_EXECUTE_STAGE",
  187163. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:769.23-769.55"
  187164. }
  187165. },
  187166. "cpu_I.execute_BYPASSABLE_MEMORY_STAGE": {
  187167. "hide_name": 0,
  187168. "bits": [ 3974 ],
  187169. "attributes": {
  187170. "hdlname": "cpu_I execute_BYPASSABLE_MEMORY_STAGE",
  187171. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:701.23-701.54"
  187172. }
  187173. },
  187174. "cpu_I.execute_BranchPlugin_branchAdder": {
  187175. "hide_name": 0,
  187176. "bits": [ 7130, 7129, 4370, 4380, 4384, 4388, 4392, 4396, 4397, 4312, 4358, 4401, 4407, 4412, 4417, 4422, 4427, 4429, 4316, 4324, 4328, 4331, 4334, 4337, 4340, 4343, 4346, 4349, 4361, 4364, 4366, 4308 ],
  187177. "attributes": {
  187178. "hdlname": "cpu_I execute_BranchPlugin_branchAdder",
  187179. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1142.23-1142.55",
  187180. "unused_bits": "0 1"
  187181. }
  187182. },
  187183. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I1": {
  187184. "hide_name": 0,
  187185. "bits": [ "0", 4313, 4314, 4315 ],
  187186. "attributes": {
  187187. "force_downto": "00000000000000000000000000000001",
  187188. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187189. }
  187190. },
  187191. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I1_SB_LUT4_O_1_I3": {
  187192. "hide_name": 0,
  187193. "bits": [ 943, 4267, 3969, 4317 ],
  187194. "attributes": {
  187195. "force_downto": "00000000000000000000000000000001",
  187196. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187197. }
  187198. },
  187199. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_10_I3": {
  187200. "hide_name": 0,
  187201. "bits": [ 4315 ],
  187202. "attributes": {
  187203. "abc9_carry": "00000000000000000000000000000001",
  187204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187205. }
  187206. },
  187207. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I1": {
  187208. "hide_name": 0,
  187209. "bits": [ "0", 4321, 4322, 4323 ],
  187210. "attributes": {
  187211. "force_downto": "00000000000000000000000000000001",
  187212. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187213. }
  187214. },
  187215. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I1_SB_LUT4_O_1_I3": {
  187216. "hide_name": 0,
  187217. "bits": [ 943, 4267, 3969, 4325 ],
  187218. "attributes": {
  187219. "force_downto": "00000000000000000000000000000001",
  187220. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187221. }
  187222. },
  187223. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_11_I3": {
  187224. "hide_name": 0,
  187225. "bits": [ 4323 ],
  187226. "attributes": {
  187227. "abc9_carry": "00000000000000000000000000000001",
  187228. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187229. }
  187230. },
  187231. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_12_I1": {
  187232. "hide_name": 0,
  187233. "bits": [ "0", 4326, 4306, 4327 ],
  187234. "attributes": {
  187235. "force_downto": "00000000000000000000000000000001",
  187236. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187237. }
  187238. },
  187239. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_12_I3": {
  187240. "hide_name": 0,
  187241. "bits": [ 4327 ],
  187242. "attributes": {
  187243. "abc9_carry": "00000000000000000000000000000001",
  187244. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187245. }
  187246. },
  187247. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_13_I1": {
  187248. "hide_name": 0,
  187249. "bits": [ "0", 4329, 4306, 4330 ],
  187250. "attributes": {
  187251. "force_downto": "00000000000000000000000000000001",
  187252. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187253. }
  187254. },
  187255. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_13_I3": {
  187256. "hide_name": 0,
  187257. "bits": [ 4330 ],
  187258. "attributes": {
  187259. "abc9_carry": "00000000000000000000000000000001",
  187260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187261. }
  187262. },
  187263. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_14_I1": {
  187264. "hide_name": 0,
  187265. "bits": [ "0", 4332, 4306, 4333 ],
  187266. "attributes": {
  187267. "force_downto": "00000000000000000000000000000001",
  187268. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187269. }
  187270. },
  187271. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_14_I3": {
  187272. "hide_name": 0,
  187273. "bits": [ 4333 ],
  187274. "attributes": {
  187275. "abc9_carry": "00000000000000000000000000000001",
  187276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187277. }
  187278. },
  187279. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_15_I1": {
  187280. "hide_name": 0,
  187281. "bits": [ "0", 4335, 4306, 4336 ],
  187282. "attributes": {
  187283. "force_downto": "00000000000000000000000000000001",
  187284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187285. }
  187286. },
  187287. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_15_I3": {
  187288. "hide_name": 0,
  187289. "bits": [ 4336 ],
  187290. "attributes": {
  187291. "abc9_carry": "00000000000000000000000000000001",
  187292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187293. }
  187294. },
  187295. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_16_I1": {
  187296. "hide_name": 0,
  187297. "bits": [ "0", 4338, 4306, 4339 ],
  187298. "attributes": {
  187299. "force_downto": "00000000000000000000000000000001",
  187300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187301. }
  187302. },
  187303. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_16_I3": {
  187304. "hide_name": 0,
  187305. "bits": [ 4339 ],
  187306. "attributes": {
  187307. "abc9_carry": "00000000000000000000000000000001",
  187308. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187309. }
  187310. },
  187311. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_17_I1": {
  187312. "hide_name": 0,
  187313. "bits": [ "0", 4341, 4306, 4342 ],
  187314. "attributes": {
  187315. "force_downto": "00000000000000000000000000000001",
  187316. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187317. }
  187318. },
  187319. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_17_I3": {
  187320. "hide_name": 0,
  187321. "bits": [ 4342 ],
  187322. "attributes": {
  187323. "abc9_carry": "00000000000000000000000000000001",
  187324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187325. }
  187326. },
  187327. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_18_I1": {
  187328. "hide_name": 0,
  187329. "bits": [ "0", 4344, 4306, 4345 ],
  187330. "attributes": {
  187331. "force_downto": "00000000000000000000000000000001",
  187332. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187333. }
  187334. },
  187335. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_18_I3": {
  187336. "hide_name": 0,
  187337. "bits": [ 4345 ],
  187338. "attributes": {
  187339. "abc9_carry": "00000000000000000000000000000001",
  187340. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187341. }
  187342. },
  187343. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_19_I1": {
  187344. "hide_name": 0,
  187345. "bits": [ "0", 4347, 4306, 4348 ],
  187346. "attributes": {
  187347. "force_downto": "00000000000000000000000000000001",
  187348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187349. }
  187350. },
  187351. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_19_I3": {
  187352. "hide_name": 0,
  187353. "bits": [ 4348 ],
  187354. "attributes": {
  187355. "abc9_carry": "00000000000000000000000000000001",
  187356. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187357. }
  187358. },
  187359. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1": {
  187360. "hide_name": 0,
  187361. "bits": [ "0", 4309, 4310, 4311 ],
  187362. "attributes": {
  187363. "force_downto": "00000000000000000000000000000001",
  187364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187365. }
  187366. },
  187367. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O_1_I3": {
  187368. "hide_name": 0,
  187369. "bits": [ 943, 4350 ],
  187370. "attributes": {
  187371. "force_downto": "00000000000000000000000000000001",
  187372. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187373. }
  187374. },
  187375. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I1_SB_LUT4_O_1_I3_SB_LUT4_I3_O": {
  187376. "hide_name": 0,
  187377. "bits": [ "0", 4351, 4306, 4365 ],
  187378. "attributes": {
  187379. "force_downto": "00000000000000000000000000000001",
  187380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187381. }
  187382. },
  187383. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_1_I3": {
  187384. "hide_name": 0,
  187385. "bits": [ 4311 ],
  187386. "attributes": {
  187387. "abc9_carry": "00000000000000000000000000000001",
  187388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187389. }
  187390. },
  187391. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_20_I1": {
  187392. "hide_name": 0,
  187393. "bits": [ "0", 4359, 4306, 4360 ],
  187394. "attributes": {
  187395. "force_downto": "00000000000000000000000000000001",
  187396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187397. }
  187398. },
  187399. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_20_I3": {
  187400. "hide_name": 0,
  187401. "bits": [ 4360 ],
  187402. "attributes": {
  187403. "abc9_carry": "00000000000000000000000000000001",
  187404. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187405. }
  187406. },
  187407. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_21_I1": {
  187408. "hide_name": 0,
  187409. "bits": [ "0", 4362, 4306, 4363 ],
  187410. "attributes": {
  187411. "force_downto": "00000000000000000000000000000001",
  187412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187413. }
  187414. },
  187415. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_21_I3": {
  187416. "hide_name": 0,
  187417. "bits": [ 4363 ],
  187418. "attributes": {
  187419. "abc9_carry": "00000000000000000000000000000001",
  187420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187421. }
  187422. },
  187423. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_22_I3": {
  187424. "hide_name": 0,
  187425. "bits": [ 4365 ],
  187426. "attributes": {
  187427. "abc9_carry": "00000000000000000000000000000001",
  187428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187429. }
  187430. },
  187431. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I1": {
  187432. "hide_name": 0,
  187433. "bits": [ "0", 4367, 4368, 4369 ],
  187434. "attributes": {
  187435. "force_downto": "00000000000000000000000000000001",
  187436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187437. }
  187438. },
  187439. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3": {
  187440. "hide_name": 0,
  187441. "bits": [ 4369 ],
  187442. "attributes": {
  187443. "abc9_carry": "00000000000000000000000000000001",
  187444. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187445. }
  187446. },
  187447. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_CI": {
  187448. "hide_name": 0,
  187449. "bits": [ 4371 ],
  187450. "attributes": {
  187451. "abc9_carry": "00000000000000000000000000000001",
  187452. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187453. }
  187454. },
  187455. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  187456. "hide_name": 0,
  187457. "bits": [ 4374 ],
  187458. "attributes": {
  187459. }
  187460. },
  187461. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I1": {
  187462. "hide_name": 0,
  187463. "bits": [ 4375 ],
  187464. "attributes": {
  187465. }
  187466. },
  187467. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_I0": {
  187468. "hide_name": 0,
  187469. "bits": [ 4372 ],
  187470. "attributes": {
  187471. }
  187472. },
  187473. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_I1": {
  187474. "hide_name": 0,
  187475. "bits": [ 4373 ],
  187476. "attributes": {
  187477. }
  187478. },
  187479. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_23_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3": {
  187480. "hide_name": 0,
  187481. "bits": [ 948, 4267, 3969, 4376 ],
  187482. "attributes": {
  187483. "force_downto": "00000000000000000000000000000001",
  187484. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187485. }
  187486. },
  187487. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_24_I1": {
  187488. "hide_name": 0,
  187489. "bits": [ "0", 4377, 4378, 4379 ],
  187490. "attributes": {
  187491. "force_downto": "00000000000000000000000000000001",
  187492. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187493. }
  187494. },
  187495. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_24_I3": {
  187496. "hide_name": 0,
  187497. "bits": [ 4379 ],
  187498. "attributes": {
  187499. "abc9_carry": "00000000000000000000000000000001",
  187500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187501. }
  187502. },
  187503. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_25_I1": {
  187504. "hide_name": 0,
  187505. "bits": [ "0", 4381, 4382, 4383 ],
  187506. "attributes": {
  187507. "force_downto": "00000000000000000000000000000001",
  187508. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187509. }
  187510. },
  187511. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_25_I3": {
  187512. "hide_name": 0,
  187513. "bits": [ 4383 ],
  187514. "attributes": {
  187515. "abc9_carry": "00000000000000000000000000000001",
  187516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187517. }
  187518. },
  187519. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_26_I1": {
  187520. "hide_name": 0,
  187521. "bits": [ "0", 4385, 4386, 4387 ],
  187522. "attributes": {
  187523. "force_downto": "00000000000000000000000000000001",
  187524. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187525. }
  187526. },
  187527. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_26_I3": {
  187528. "hide_name": 0,
  187529. "bits": [ 4387 ],
  187530. "attributes": {
  187531. "abc9_carry": "00000000000000000000000000000001",
  187532. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187533. }
  187534. },
  187535. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_27_I1": {
  187536. "hide_name": 0,
  187537. "bits": [ "0", 4389, 4390, 4391 ],
  187538. "attributes": {
  187539. "force_downto": "00000000000000000000000000000001",
  187540. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187541. }
  187542. },
  187543. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_27_I3": {
  187544. "hide_name": 0,
  187545. "bits": [ 4391 ],
  187546. "attributes": {
  187547. "abc9_carry": "00000000000000000000000000000001",
  187548. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187549. }
  187550. },
  187551. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_28_I1": {
  187552. "hide_name": 0,
  187553. "bits": [ "0", 4393, 4394, 4395 ],
  187554. "attributes": {
  187555. "force_downto": "00000000000000000000000000000001",
  187556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187557. }
  187558. },
  187559. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_28_I3": {
  187560. "hide_name": 0,
  187561. "bits": [ 4395 ],
  187562. "attributes": {
  187563. "abc9_carry": "00000000000000000000000000000001",
  187564. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187565. }
  187566. },
  187567. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_29_I1": {
  187568. "hide_name": 0,
  187569. "bits": [ "0", 4353, 4354, 4352 ],
  187570. "attributes": {
  187571. "force_downto": "00000000000000000000000000000001",
  187572. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187573. }
  187574. },
  187575. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_29_I3": {
  187576. "hide_name": 0,
  187577. "bits": [ 4352 ],
  187578. "attributes": {
  187579. "abc9_carry": "00000000000000000000000000000001",
  187580. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187581. }
  187582. },
  187583. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_2_I1": {
  187584. "hide_name": 0,
  187585. "bits": [ "0", 4355, 4356, 4357 ],
  187586. "attributes": {
  187587. "force_downto": "00000000000000000000000000000001",
  187588. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187589. }
  187590. },
  187591. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_2_I3": {
  187592. "hide_name": 0,
  187593. "bits": [ 4357 ],
  187594. "attributes": {
  187595. "abc9_carry": "00000000000000000000000000000001",
  187596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187597. }
  187598. },
  187599. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1": {
  187600. "hide_name": 0,
  187601. "bits": [ "0", 4398, 4399, 4400 ],
  187602. "attributes": {
  187603. "force_downto": "00000000000000000000000000000001",
  187604. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187605. }
  187606. },
  187607. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1_SB_LUT4_O_1_I3": {
  187608. "hide_name": 0,
  187609. "bits": [ 943, 3969, 4402 ],
  187610. "attributes": {
  187611. "force_downto": "00000000000000000000000000000001",
  187612. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187613. }
  187614. },
  187615. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  187616. "hide_name": 0,
  187617. "bits": [ 950, 3967, 3968, 4403 ],
  187618. "attributes": {
  187619. "force_downto": "00000000000000000000000000000001",
  187620. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187621. }
  187622. },
  187623. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_3_I3": {
  187624. "hide_name": 0,
  187625. "bits": [ 4400 ],
  187626. "attributes": {
  187627. "abc9_carry": "00000000000000000000000000000001",
  187628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187629. }
  187630. },
  187631. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I1": {
  187632. "hide_name": 0,
  187633. "bits": [ "0", 4404, 4405, 4406 ],
  187634. "attributes": {
  187635. "force_downto": "00000000000000000000000000000001",
  187636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187637. }
  187638. },
  187639. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I1_SB_LUT4_O_1_I3": {
  187640. "hide_name": 0,
  187641. "bits": [ 943, 4267, 3969, 4408 ],
  187642. "attributes": {
  187643. "force_downto": "00000000000000000000000000000001",
  187644. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187645. }
  187646. },
  187647. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_4_I3": {
  187648. "hide_name": 0,
  187649. "bits": [ 4406 ],
  187650. "attributes": {
  187651. "abc9_carry": "00000000000000000000000000000001",
  187652. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187653. }
  187654. },
  187655. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I1": {
  187656. "hide_name": 0,
  187657. "bits": [ "0", 4409, 4410, 4411 ],
  187658. "attributes": {
  187659. "force_downto": "00000000000000000000000000000001",
  187660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187661. }
  187662. },
  187663. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I1_SB_LUT4_O_1_I3": {
  187664. "hide_name": 0,
  187665. "bits": [ 943, 4267, 3969, 4413 ],
  187666. "attributes": {
  187667. "force_downto": "00000000000000000000000000000001",
  187668. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187669. }
  187670. },
  187671. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_5_I3": {
  187672. "hide_name": 0,
  187673. "bits": [ 4411 ],
  187674. "attributes": {
  187675. "abc9_carry": "00000000000000000000000000000001",
  187676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187677. }
  187678. },
  187679. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I1": {
  187680. "hide_name": 0,
  187681. "bits": [ "0", 4414, 4415, 4416 ],
  187682. "attributes": {
  187683. "force_downto": "00000000000000000000000000000001",
  187684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187685. }
  187686. },
  187687. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I1_SB_LUT4_O_1_I3": {
  187688. "hide_name": 0,
  187689. "bits": [ 943, 4267, 3969, 4418 ],
  187690. "attributes": {
  187691. "force_downto": "00000000000000000000000000000001",
  187692. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187693. }
  187694. },
  187695. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_6_I3": {
  187696. "hide_name": 0,
  187697. "bits": [ 4416 ],
  187698. "attributes": {
  187699. "abc9_carry": "00000000000000000000000000000001",
  187700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187701. }
  187702. },
  187703. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I1": {
  187704. "hide_name": 0,
  187705. "bits": [ "0", 4419, 4420, 4421 ],
  187706. "attributes": {
  187707. "force_downto": "00000000000000000000000000000001",
  187708. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187709. }
  187710. },
  187711. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I1_SB_LUT4_O_1_I3": {
  187712. "hide_name": 0,
  187713. "bits": [ 943, 4267, 3969, 4423 ],
  187714. "attributes": {
  187715. "force_downto": "00000000000000000000000000000001",
  187716. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187717. }
  187718. },
  187719. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_7_I3": {
  187720. "hide_name": 0,
  187721. "bits": [ 4421 ],
  187722. "attributes": {
  187723. "abc9_carry": "00000000000000000000000000000001",
  187724. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187725. }
  187726. },
  187727. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I1": {
  187728. "hide_name": 0,
  187729. "bits": [ "0", 4424, 4425, 4426 ],
  187730. "attributes": {
  187731. "force_downto": "00000000000000000000000000000001",
  187732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187733. }
  187734. },
  187735. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I1_SB_LUT4_O_1_I3": {
  187736. "hide_name": 0,
  187737. "bits": [ 943, 4267, 3969, 4428 ],
  187738. "attributes": {
  187739. "force_downto": "00000000000000000000000000000001",
  187740. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187741. }
  187742. },
  187743. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_8_I3": {
  187744. "hide_name": 0,
  187745. "bits": [ 4426 ],
  187746. "attributes": {
  187747. "abc9_carry": "00000000000000000000000000000001",
  187748. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187749. }
  187750. },
  187751. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I1": {
  187752. "hide_name": 0,
  187753. "bits": [ "0", 4319, 4320, 4318 ],
  187754. "attributes": {
  187755. "force_downto": "00000000000000000000000000000001",
  187756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187757. }
  187758. },
  187759. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I1_SB_LUT4_O_1_I3": {
  187760. "hide_name": 0,
  187761. "bits": [ 943, 4267, 3969, 4430 ],
  187762. "attributes": {
  187763. "force_downto": "00000000000000000000000000000001",
  187764. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187765. }
  187766. },
  187767. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_9_I3": {
  187768. "hide_name": 0,
  187769. "bits": [ 4318 ],
  187770. "attributes": {
  187771. "abc9_carry": "00000000000000000000000000000001",
  187772. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187773. }
  187774. },
  187775. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_I1": {
  187776. "hide_name": 0,
  187777. "bits": [ "0", 4305, 4306, 4307 ],
  187778. "attributes": {
  187779. "force_downto": "00000000000000000000000000000001",
  187780. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187781. }
  187782. },
  187783. "cpu_I.execute_BranchPlugin_branchAdder_SB_LUT4_O_I3": {
  187784. "hide_name": 0,
  187785. "bits": [ 4307 ],
  187786. "attributes": {
  187787. "abc9_carry": "00000000000000000000000000000001",
  187788. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:3860.46-3860.113|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  187789. }
  187790. },
  187791. "cpu_I.execute_BranchPlugin_branch_src2": {
  187792. "hide_name": 0,
  187793. "bits": [ 7131, 7132, 7133, 7134, 7135, 7136, 7137, 7138, 7139, 7140, 7141, 7142, 7143, 7144, 7145, 7146, 7147, 7148, 7149, 7150, 7151, 7151, 7151, 7151, 7151, 7151, 7151, 7151, 7151, 7151, 7151, 7151 ],
  187794. "attributes": {
  187795. "hdlname": "cpu_I execute_BranchPlugin_branch_src2",
  187796. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1135.23-1135.55",
  187797. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31"
  187798. }
  187799. },
  187800. "cpu_I.execute_CSR_WRITE_OPCODE": {
  187801. "hide_name": 0,
  187802. "bits": [ 3975 ],
  187803. "attributes": {
  187804. "hdlname": "cpu_I execute_CSR_WRITE_OPCODE",
  187805. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:749.23-749.47"
  187806. }
  187807. },
  187808. "cpu_I.execute_CsrPlugin_csrAddress": {
  187809. "hide_name": 0,
  187810. "bits": [ 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  187811. "attributes": {
  187812. "hdlname": "cpu_I execute_CsrPlugin_csrAddress",
  187813. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1204.23-1204.51"
  187814. }
  187815. },
  187816. "cpu_I.execute_CsrPlugin_csr_1984": {
  187817. "hide_name": 0,
  187818. "bits": [ 4432 ],
  187819. "attributes": {
  187820. "hdlname": "cpu_I execute_CsrPlugin_csr_1984",
  187821. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1310.23-1310.49"
  187822. }
  187823. },
  187824. "cpu_I.execute_CsrPlugin_csr_1984_SB_DFFE_Q_D": {
  187825. "hide_name": 0,
  187826. "bits": [ 4431 ],
  187827. "attributes": {
  187828. }
  187829. },
  187830. "cpu_I.execute_CsrPlugin_csr_1984_SB_LUT4_I2_O": {
  187831. "hide_name": 0,
  187832. "bits": [ 2259, 2260, 2261, 2262 ],
  187833. "attributes": {
  187834. "force_downto": "00000000000000000000000000000001",
  187835. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187836. }
  187837. },
  187838. "cpu_I.execute_CsrPlugin_csr_1984_SB_LUT4_I2_O_SB_DFFR_Q_D": {
  187839. "hide_name": 0,
  187840. "bits": [ 4435 ],
  187841. "attributes": {
  187842. }
  187843. },
  187844. "cpu_I.execute_CsrPlugin_csr_3008": {
  187845. "hide_name": 0,
  187846. "bits": [ 1037 ],
  187847. "attributes": {
  187848. "hdlname": "cpu_I execute_CsrPlugin_csr_3008",
  187849. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1318.23-1318.49"
  187850. }
  187851. },
  187852. "cpu_I.execute_CsrPlugin_csr_3008_SB_DFFE_Q_D": {
  187853. "hide_name": 0,
  187854. "bits": [ 4436 ],
  187855. "attributes": {
  187856. }
  187857. },
  187858. "cpu_I.execute_CsrPlugin_csr_768": {
  187859. "hide_name": 0,
  187860. "bits": [ 1042 ],
  187861. "attributes": {
  187862. "hdlname": "cpu_I execute_CsrPlugin_csr_768",
  187863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1311.23-1311.48"
  187864. }
  187865. },
  187866. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D": {
  187867. "hide_name": 0,
  187868. "bits": [ 4437 ],
  187869. "attributes": {
  187870. }
  187871. },
  187872. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3": {
  187873. "hide_name": 0,
  187874. "bits": [ 4441, 4440 ],
  187875. "attributes": {
  187876. "force_downto": "00000000000000000000000000000001",
  187877. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187878. }
  187879. },
  187880. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2_O": {
  187881. "hide_name": 0,
  187882. "bits": [ 1821, 1528, 4433, 4434 ],
  187883. "attributes": {
  187884. "force_downto": "00000000000000000000000000000001",
  187885. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187886. }
  187887. },
  187888. "cpu_I.execute_CsrPlugin_csr_768_SB_DFFE_Q_D_SB_LUT4_O_I3_SB_LUT4_I2_O_SB_LUT4_I3_O": {
  187889. "hide_name": 0,
  187890. "bits": [ 1547, 4438, 4442, 4439 ],
  187891. "attributes": {
  187892. "force_downto": "00000000000000000000000000000001",
  187893. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187894. }
  187895. },
  187896. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1_O": {
  187897. "hide_name": 0,
  187898. "bits": [ 1037, 4445, 4444, 4446 ],
  187899. "attributes": {
  187900. "force_downto": "00000000000000000000000000000001",
  187901. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187902. }
  187903. },
  187904. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_1_O_SB_LUT4_I1_O": {
  187905. "hide_name": 0,
  187906. "bits": [ 964, 966, 2522, 2873 ],
  187907. "attributes": {
  187908. "force_downto": "00000000000000000000000000000001",
  187909. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187910. }
  187911. },
  187912. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_O": {
  187913. "hide_name": 0,
  187914. "bits": [ 1050, 1047, 1146, 1147 ],
  187915. "attributes": {
  187916. "force_downto": "00000000000000000000000000000001",
  187917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187918. }
  187919. },
  187920. "cpu_I.execute_CsrPlugin_csr_768_SB_LUT4_I2_O_SB_LUT4_O_I1": {
  187921. "hide_name": 0,
  187922. "bits": [ 4447, 4448, 4449 ],
  187923. "attributes": {
  187924. "force_downto": "00000000000000000000000000000001",
  187925. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187926. }
  187927. },
  187928. "cpu_I.execute_CsrPlugin_csr_772": {
  187929. "hide_name": 0,
  187930. "bits": [ 1035 ],
  187931. "attributes": {
  187932. "hdlname": "cpu_I execute_CsrPlugin_csr_772",
  187933. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1313.23-1313.48"
  187934. }
  187935. },
  187936. "cpu_I.execute_CsrPlugin_csr_772_SB_DFFE_Q_D": {
  187937. "hide_name": 0,
  187938. "bits": [ 4452 ],
  187939. "attributes": {
  187940. }
  187941. },
  187942. "cpu_I.execute_CsrPlugin_csr_773": {
  187943. "hide_name": 0,
  187944. "bits": [ 4454 ],
  187945. "attributes": {
  187946. "hdlname": "cpu_I execute_CsrPlugin_csr_773",
  187947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1314.23-1314.48"
  187948. }
  187949. },
  187950. "cpu_I.execute_CsrPlugin_csr_773_SB_DFFE_Q_D": {
  187951. "hide_name": 0,
  187952. "bits": [ 4453 ],
  187953. "attributes": {
  187954. }
  187955. },
  187956. "cpu_I.execute_CsrPlugin_csr_773_SB_DFFE_Q_D_SB_LUT4_O_I2": {
  187957. "hide_name": 0,
  187958. "bits": [ 1547, 4438, 4455, 4439 ],
  187959. "attributes": {
  187960. "force_downto": "00000000000000000000000000000001",
  187961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187962. }
  187963. },
  187964. "cpu_I.execute_CsrPlugin_csr_773_SB_LUT4_I2_O": {
  187965. "hide_name": 0,
  187966. "bits": [ 1183 ],
  187967. "attributes": {
  187968. }
  187969. },
  187970. "cpu_I.execute_CsrPlugin_csr_833": {
  187971. "hide_name": 0,
  187972. "bits": [ 1043 ],
  187973. "attributes": {
  187974. "hdlname": "cpu_I execute_CsrPlugin_csr_833",
  187975. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1315.23-1315.48"
  187976. }
  187977. },
  187978. "cpu_I.execute_CsrPlugin_csr_833_SB_DFFE_Q_D": {
  187979. "hide_name": 0,
  187980. "bits": [ 4456 ],
  187981. "attributes": {
  187982. }
  187983. },
  187984. "cpu_I.execute_CsrPlugin_csr_833_SB_DFFE_Q_D_SB_LUT4_O_I2": {
  187985. "hide_name": 0,
  187986. "bits": [ 1552, 1530, 4443 ],
  187987. "attributes": {
  187988. "force_downto": "00000000000000000000000000000001",
  187989. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  187990. }
  187991. },
  187992. "cpu_I.execute_CsrPlugin_csr_834": {
  187993. "hide_name": 0,
  187994. "bits": [ 1029 ],
  187995. "attributes": {
  187996. "hdlname": "cpu_I execute_CsrPlugin_csr_834",
  187997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1316.23-1316.48"
  187998. }
  187999. },
  188000. "cpu_I.execute_CsrPlugin_csr_834_SB_DFFE_Q_D": {
  188001. "hide_name": 0,
  188002. "bits": [ 4458 ],
  188003. "attributes": {
  188004. }
  188005. },
  188006. "cpu_I.execute_CsrPlugin_csr_835": {
  188007. "hide_name": 0,
  188008. "bits": [ 1034 ],
  188009. "attributes": {
  188010. "hdlname": "cpu_I execute_CsrPlugin_csr_835",
  188011. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1317.23-1317.48"
  188012. }
  188013. },
  188014. "cpu_I.execute_CsrPlugin_csr_835_SB_DFFE_Q_D": {
  188015. "hide_name": 0,
  188016. "bits": [ 4459 ],
  188017. "attributes": {
  188018. }
  188019. },
  188020. "cpu_I.execute_CsrPlugin_csr_836": {
  188021. "hide_name": 0,
  188022. "bits": [ 1128 ],
  188023. "attributes": {
  188024. "hdlname": "cpu_I execute_CsrPlugin_csr_836",
  188025. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1312.23-1312.48"
  188026. }
  188027. },
  188028. "cpu_I.execute_CsrPlugin_csr_836_SB_DFFE_Q_D": {
  188029. "hide_name": 0,
  188030. "bits": [ 4460 ],
  188031. "attributes": {
  188032. }
  188033. },
  188034. "cpu_I.execute_CsrPlugin_csr_836_SB_DFFE_Q_D_SB_LUT4_O_I3": {
  188035. "hide_name": 0,
  188036. "bits": [ 4442, 4457 ],
  188037. "attributes": {
  188038. "force_downto": "00000000000000000000000000000001",
  188039. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188040. }
  188041. },
  188042. "cpu_I.execute_CsrPlugin_writeData": {
  188043. "hide_name": 0,
  188044. "bits": [ 2262, 2763, 1223, 1039, 1220, 1218, 1216, 1054, 1213, 1211, 1209, 1136, 1146, 1203, 1201, 1199, 1197, 1195, 1193, 1191, 1189, 1187, 1237, 1235, 1233, 1231, 1229, 1227, 1225, 1206, 1185, 1059 ],
  188045. "attributes": {
  188046. "hdlname": "cpu_I execute_CsrPlugin_writeData",
  188047. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1203.23-1203.50"
  188048. }
  188049. },
  188050. "cpu_I.execute_DBusSimplePlugin_skipCmd": {
  188051. "hide_name": 0,
  188052. "bits": [ "0" ],
  188053. "attributes": {
  188054. "hdlname": "cpu_I execute_DBusSimplePlugin_skipCmd",
  188055. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1063.23-1063.55"
  188056. }
  188057. },
  188058. "cpu_I.execute_ENV_CTRL": {
  188059. "hide_name": 0,
  188060. "bits": [ 1240, 1239 ],
  188061. "attributes": {
  188062. "hdlname": "cpu_I execute_ENV_CTRL",
  188063. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:753.20-753.36"
  188064. }
  188065. },
  188066. "cpu_I.execute_INSTRUCTION": {
  188067. "hide_name": 0,
  188068. "bits": [ 994, 992, 988, 986, 984, 982, 980, 978, 976, 974, 972, 970, 966, 964, 962, 960, 958, 956, 954, 952, 950, 948, 1006, 1004, 1002, 1000, 998, 996, 990, 968, 946, 943 ],
  188069. "attributes": {
  188070. "hdlname": "cpu_I execute_INSTRUCTION",
  188071. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:839.23-839.42"
  188072. }
  188073. },
  188074. "cpu_I.execute_IS_CSR": {
  188075. "hide_name": 0,
  188076. "bits": [ 3977 ],
  188077. "attributes": {
  188078. "hdlname": "cpu_I execute_IS_CSR",
  188079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:750.23-750.37"
  188080. }
  188081. },
  188082. "cpu_I.execute_IS_DIV": {
  188083. "hide_name": 0,
  188084. "bits": [ 3984 ],
  188085. "attributes": {
  188086. "hdlname": "cpu_I execute_IS_DIV",
  188087. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:739.23-739.37"
  188088. }
  188089. },
  188090. "cpu_I.execute_IS_MUL": {
  188091. "hide_name": 0,
  188092. "bits": [ 4136 ],
  188093. "attributes": {
  188094. "hdlname": "cpu_I execute_IS_MUL",
  188095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:732.23-732.37"
  188096. }
  188097. },
  188098. "cpu_I.execute_IS_RS1_SIGNED": {
  188099. "hide_name": 0,
  188100. "bits": [ 3985 ],
  188101. "attributes": {
  188102. "hdlname": "cpu_I execute_IS_RS1_SIGNED",
  188103. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:738.23-738.44"
  188104. }
  188105. },
  188106. "cpu_I.execute_IS_RS2_SIGNED": {
  188107. "hide_name": 0,
  188108. "bits": [ 3985 ],
  188109. "attributes": {
  188110. "hdlname": "cpu_I execute_IS_RS2_SIGNED",
  188111. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:740.23-740.44"
  188112. }
  188113. },
  188114. "cpu_I.execute_MEMORY_ADDRESS_LOW": {
  188115. "hide_name": 0,
  188116. "bits": [ 2775, 3078 ],
  188117. "attributes": {
  188118. "hdlname": "cpu_I execute_MEMORY_ADDRESS_LOW",
  188119. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:681.23-681.49"
  188120. }
  188121. },
  188122. "cpu_I.execute_MEMORY_ENABLE": {
  188123. "hide_name": 0,
  188124. "bits": [ 3980 ],
  188125. "attributes": {
  188126. "hdlname": "cpu_I execute_MEMORY_ENABLE",
  188127. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:841.23-841.44"
  188128. }
  188129. },
  188130. "cpu_I.execute_MEMORY_STORE": {
  188131. "hide_name": 0,
  188132. "bits": [ 982 ],
  188133. "attributes": {
  188134. "hdlname": "cpu_I execute_MEMORY_STORE",
  188135. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:840.23-840.43"
  188136. }
  188137. },
  188138. "cpu_I.execute_MMU_FAULT": {
  188139. "hide_name": 0,
  188140. "bits": [ "0" ],
  188141. "attributes": {
  188142. "hdlname": "cpu_I execute_MMU_FAULT",
  188143. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:829.23-829.40"
  188144. }
  188145. },
  188146. "cpu_I.execute_MMU_RSP_allowExecute": {
  188147. "hide_name": 0,
  188148. "bits": [ "1" ],
  188149. "attributes": {
  188150. "hdlname": "cpu_I execute_MMU_RSP_allowExecute",
  188151. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:834.23-834.51"
  188152. }
  188153. },
  188154. "cpu_I.execute_MMU_RSP_allowRead": {
  188155. "hide_name": 0,
  188156. "bits": [ "1" ],
  188157. "attributes": {
  188158. "hdlname": "cpu_I execute_MMU_RSP_allowRead",
  188159. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:832.23-832.48"
  188160. }
  188161. },
  188162. "cpu_I.execute_MMU_RSP_allowWrite": {
  188163. "hide_name": 0,
  188164. "bits": [ "1" ],
  188165. "attributes": {
  188166. "hdlname": "cpu_I execute_MMU_RSP_allowWrite",
  188167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:833.23-833.49"
  188168. }
  188169. },
  188170. "cpu_I.execute_MMU_RSP_exception": {
  188171. "hide_name": 0,
  188172. "bits": [ "0" ],
  188173. "attributes": {
  188174. "hdlname": "cpu_I execute_MMU_RSP_exception",
  188175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:835.23-835.48"
  188176. }
  188177. },
  188178. "cpu_I.execute_MMU_RSP_isIoAccess": {
  188179. "hide_name": 0,
  188180. "bits": [ 1244 ],
  188181. "attributes": {
  188182. "hdlname": "cpu_I execute_MMU_RSP_isIoAccess",
  188183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:831.23-831.49"
  188184. }
  188185. },
  188186. "cpu_I.execute_MMU_RSP_physicalAddress": {
  188187. "hide_name": 0,
  188188. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  188189. "attributes": {
  188190. "hdlname": "cpu_I execute_MMU_RSP_physicalAddress",
  188191. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:830.23-830.54",
  188192. "unused_bits": "28 29"
  188193. }
  188194. },
  188195. "cpu_I.execute_MMU_RSP_refilling": {
  188196. "hide_name": 0,
  188197. "bits": [ "0" ],
  188198. "attributes": {
  188199. "hdlname": "cpu_I execute_MMU_RSP_refilling",
  188200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:836.23-836.48"
  188201. }
  188202. },
  188203. "cpu_I.execute_MUL_HH": {
  188204. "hide_name": 0,
  188205. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 4519, 4557, 4562, 4564, 4472, 4489, 4498, 4505, 4512, 4468, 4538, 4542, 4546, 4550, 4554, 4464, "x", "x" ],
  188206. "attributes": {
  188207. "hdlname": "cpu_I execute_MUL_HH",
  188208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:737.23-737.37"
  188209. }
  188210. },
  188211. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1": {
  188212. "hide_name": 0,
  188213. "bits": [ "0", 4469, 4470, 4471 ],
  188214. "attributes": {
  188215. "force_downto": "00000000000000000000000000000001",
  188216. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188217. }
  188218. },
  188219. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O_I2": {
  188220. "hide_name": 0,
  188221. "bits": [ 4473, 4474, 4475 ],
  188222. "attributes": {
  188223. "force_downto": "00000000000000000000000000000001",
  188224. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188225. }
  188226. },
  188227. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I1_SB_LUT4_O_I2_SB_LUT4_O_I1": {
  188228. "hide_name": 0,
  188229. "bits": [ "0", 4479, "0", 4480 ],
  188230. "attributes": {
  188231. "force_downto": "00000000000000000000000000000001",
  188232. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188233. }
  188234. },
  188235. "cpu_I.execute_MUL_HH_SB_LUT4_O_10_I3": {
  188236. "hide_name": 0,
  188237. "bits": [ 4471 ],
  188238. "attributes": {
  188239. "abc9_carry": "00000000000000000000000000000001",
  188240. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188241. }
  188242. },
  188243. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I1": {
  188244. "hide_name": 0,
  188245. "bits": [ "0", 4486, 4487, 4488 ],
  188246. "attributes": {
  188247. "force_downto": "00000000000000000000000000000001",
  188248. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188249. }
  188250. },
  188251. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I1_SB_LUT4_O_I2": {
  188252. "hide_name": 0,
  188253. "bits": [ 4476, 4477, 4478 ],
  188254. "attributes": {
  188255. "force_downto": "00000000000000000000000000000001",
  188256. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188257. }
  188258. },
  188259. "cpu_I.execute_MUL_HH_SB_LUT4_O_11_I3": {
  188260. "hide_name": 0,
  188261. "bits": [ 4488 ],
  188262. "attributes": {
  188263. "abc9_carry": "00000000000000000000000000000001",
  188264. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188265. }
  188266. },
  188267. "cpu_I.execute_MUL_HH_SB_LUT4_O_12_I1": {
  188268. "hide_name": 0,
  188269. "bits": [ "0", 4495, 4496, 4497 ],
  188270. "attributes": {
  188271. "force_downto": "00000000000000000000000000000001",
  188272. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188273. }
  188274. },
  188275. "cpu_I.execute_MUL_HH_SB_LUT4_O_12_I3": {
  188276. "hide_name": 0,
  188277. "bits": [ 4497 ],
  188278. "attributes": {
  188279. "abc9_carry": "00000000000000000000000000000001",
  188280. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188281. }
  188282. },
  188283. "cpu_I.execute_MUL_HH_SB_LUT4_O_13_I1": {
  188284. "hide_name": 0,
  188285. "bits": [ "0", 4502, 4503, 4504 ],
  188286. "attributes": {
  188287. "force_downto": "00000000000000000000000000000001",
  188288. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188289. }
  188290. },
  188291. "cpu_I.execute_MUL_HH_SB_LUT4_O_13_I3": {
  188292. "hide_name": 0,
  188293. "bits": [ 4504 ],
  188294. "attributes": {
  188295. "abc9_carry": "00000000000000000000000000000001",
  188296. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188297. }
  188298. },
  188299. "cpu_I.execute_MUL_HH_SB_LUT4_O_14_I1": {
  188300. "hide_name": 0,
  188301. "bits": [ "0", 4509, 4510, 4511 ],
  188302. "attributes": {
  188303. "force_downto": "00000000000000000000000000000001",
  188304. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188305. }
  188306. },
  188307. "cpu_I.execute_MUL_HH_SB_LUT4_O_14_I3": {
  188308. "hide_name": 0,
  188309. "bits": [ 4511 ],
  188310. "attributes": {
  188311. "abc9_carry": "00000000000000000000000000000001",
  188312. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188313. }
  188314. },
  188315. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2": {
  188316. "hide_name": 0,
  188317. "bits": [ 4516, 4517, 4518 ],
  188318. "attributes": {
  188319. "force_downto": "00000000000000000000000000000001",
  188320. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188321. }
  188322. },
  188323. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2": {
  188324. "hide_name": 0,
  188325. "bits": [ "0", 4521, 4522, "0" ],
  188326. "attributes": {
  188327. "force_downto": "00000000000000000000000000000001",
  188328. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188329. }
  188330. },
  188331. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO": {
  188332. "hide_name": 0,
  188333. "bits": [ 4523 ],
  188334. "attributes": {
  188335. "abc9_carry": "00000000000000000000000000000001",
  188336. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188337. }
  188338. },
  188339. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO": {
  188340. "hide_name": 0,
  188341. "bits": [ 4524 ],
  188342. "attributes": {
  188343. "abc9_carry": "00000000000000000000000000000001",
  188344. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188345. }
  188346. },
  188347. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_LUT4_I3_I1": {
  188348. "hide_name": 0,
  188349. "bits": [ "0", 4526, "0", 4524 ],
  188350. "attributes": {
  188351. "force_downto": "00000000000000000000000000000001",
  188352. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188353. }
  188354. },
  188355. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_1_I2_SB_CARRY_I1_CO_SB_LUT4_I3_I1": {
  188356. "hide_name": 0,
  188357. "bits": [ "0", 4525, "0", 4523 ],
  188358. "attributes": {
  188359. "force_downto": "00000000000000000000000000000001",
  188360. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188361. }
  188362. },
  188363. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2": {
  188364. "hide_name": 0,
  188365. "bits": [ "0", 4303, 4520, "0" ],
  188366. "attributes": {
  188367. "force_downto": "00000000000000000000000000000001",
  188368. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188369. }
  188370. },
  188371. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO": {
  188372. "hide_name": 0,
  188373. "bits": [ 4529 ],
  188374. "attributes": {
  188375. "abc9_carry": "00000000000000000000000000000001",
  188376. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188377. }
  188378. },
  188379. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO": {
  188380. "hide_name": 0,
  188381. "bits": [ 4530 ],
  188382. "attributes": {
  188383. "abc9_carry": "00000000000000000000000000000001",
  188384. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188385. }
  188386. },
  188387. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO": {
  188388. "hide_name": 0,
  188389. "bits": [ 4480 ],
  188390. "attributes": {
  188391. "abc9_carry": "00000000000000000000000000000001",
  188392. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188393. }
  188394. },
  188395. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_CARRY_CI_CO_SB_LUT4_I3_I1": {
  188396. "hide_name": 0,
  188397. "bits": [ "0", 4532, "0", 4530 ],
  188398. "attributes": {
  188399. "force_downto": "00000000000000000000000000000001",
  188400. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188401. }
  188402. },
  188403. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_LUT4_I3_I1": {
  188404. "hide_name": 0,
  188405. "bits": [ "0", 4531, "0", 4529 ],
  188406. "attributes": {
  188407. "force_downto": "00000000000000000000000000000001",
  188408. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188409. }
  188410. },
  188411. "cpu_I.execute_MUL_HH_SB_LUT4_O_15_I2_SB_LUT4_O_I2_SB_CARRY_I1_CO_SB_LUT4_I3_O": {
  188412. "hide_name": 0,
  188413. "bits": [ 4558, 4528, 4534 ],
  188414. "attributes": {
  188415. "force_downto": "00000000000000000000000000000001",
  188416. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188417. }
  188418. },
  188419. "cpu_I.execute_MUL_HH_SB_LUT4_O_1_I1": {
  188420. "hide_name": 0,
  188421. "bits": [ "0", 4465, 4466, 4467 ],
  188422. "attributes": {
  188423. "force_downto": "00000000000000000000000000000001",
  188424. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188425. }
  188426. },
  188427. "cpu_I.execute_MUL_HH_SB_LUT4_O_1_I3": {
  188428. "hide_name": 0,
  188429. "bits": [ 4467 ],
  188430. "attributes": {
  188431. "abc9_carry": "00000000000000000000000000000001",
  188432. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188433. }
  188434. },
  188435. "cpu_I.execute_MUL_HH_SB_LUT4_O_2_I1": {
  188436. "hide_name": 0,
  188437. "bits": [ "0", 4535, 4536, 4537 ],
  188438. "attributes": {
  188439. "force_downto": "00000000000000000000000000000001",
  188440. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188441. }
  188442. },
  188443. "cpu_I.execute_MUL_HH_SB_LUT4_O_2_I3": {
  188444. "hide_name": 0,
  188445. "bits": [ 4537 ],
  188446. "attributes": {
  188447. "abc9_carry": "00000000000000000000000000000001",
  188448. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188449. }
  188450. },
  188451. "cpu_I.execute_MUL_HH_SB_LUT4_O_3_I1": {
  188452. "hide_name": 0,
  188453. "bits": [ "0", 4539, 4540, 4541 ],
  188454. "attributes": {
  188455. "force_downto": "00000000000000000000000000000001",
  188456. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188457. }
  188458. },
  188459. "cpu_I.execute_MUL_HH_SB_LUT4_O_3_I3": {
  188460. "hide_name": 0,
  188461. "bits": [ 4541 ],
  188462. "attributes": {
  188463. "abc9_carry": "00000000000000000000000000000001",
  188464. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188465. }
  188466. },
  188467. "cpu_I.execute_MUL_HH_SB_LUT4_O_4_I1": {
  188468. "hide_name": 0,
  188469. "bits": [ "0", 4543, 4544, 4545 ],
  188470. "attributes": {
  188471. "force_downto": "00000000000000000000000000000001",
  188472. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188473. }
  188474. },
  188475. "cpu_I.execute_MUL_HH_SB_LUT4_O_4_I3": {
  188476. "hide_name": 0,
  188477. "bits": [ 4545 ],
  188478. "attributes": {
  188479. "abc9_carry": "00000000000000000000000000000001",
  188480. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188481. }
  188482. },
  188483. "cpu_I.execute_MUL_HH_SB_LUT4_O_5_I1": {
  188484. "hide_name": 0,
  188485. "bits": [ "0", 4547, 4548, 4549 ],
  188486. "attributes": {
  188487. "force_downto": "00000000000000000000000000000001",
  188488. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188489. }
  188490. },
  188491. "cpu_I.execute_MUL_HH_SB_LUT4_O_5_I3": {
  188492. "hide_name": 0,
  188493. "bits": [ 4549 ],
  188494. "attributes": {
  188495. "abc9_carry": "00000000000000000000000000000001",
  188496. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188497. }
  188498. },
  188499. "cpu_I.execute_MUL_HH_SB_LUT4_O_6_I1": {
  188500. "hide_name": 0,
  188501. "bits": [ "0", 4551, 4552, 4553 ],
  188502. "attributes": {
  188503. "force_downto": "00000000000000000000000000000001",
  188504. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188505. }
  188506. },
  188507. "cpu_I.execute_MUL_HH_SB_LUT4_O_6_I3": {
  188508. "hide_name": 0,
  188509. "bits": [ 4553 ],
  188510. "attributes": {
  188511. "abc9_carry": "00000000000000000000000000000001",
  188512. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188513. }
  188514. },
  188515. "cpu_I.execute_MUL_HH_SB_LUT4_O_7_I1": {
  188516. "hide_name": 0,
  188517. "bits": [ "0", 4555, 4556, "0" ],
  188518. "attributes": {
  188519. "force_downto": "00000000000000000000000000000001",
  188520. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188521. }
  188522. },
  188523. "cpu_I.execute_MUL_HH_SB_LUT4_O_8_I1": {
  188524. "hide_name": 0,
  188525. "bits": [ "0", 4559, 4560, 4561 ],
  188526. "attributes": {
  188527. "force_downto": "00000000000000000000000000000001",
  188528. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188529. }
  188530. },
  188531. "cpu_I.execute_MUL_HH_SB_LUT4_O_8_I3": {
  188532. "hide_name": 0,
  188533. "bits": [ 4561 ],
  188534. "attributes": {
  188535. "abc9_carry": "00000000000000000000000000000001",
  188536. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188537. }
  188538. },
  188539. "cpu_I.execute_MUL_HH_SB_LUT4_O_9_I1": {
  188540. "hide_name": 0,
  188541. "bits": [ "0", 4484, 4485, 4483 ],
  188542. "attributes": {
  188543. "force_downto": "00000000000000000000000000000001",
  188544. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188545. }
  188546. },
  188547. "cpu_I.execute_MUL_HH_SB_LUT4_O_9_I1_SB_LUT4_O_I2": {
  188548. "hide_name": 0,
  188549. "bits": [ 4563, 4527, 4533 ],
  188550. "attributes": {
  188551. "force_downto": "00000000000000000000000000000001",
  188552. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188553. }
  188554. },
  188555. "cpu_I.execute_MUL_HH_SB_LUT4_O_9_I3": {
  188556. "hide_name": 0,
  188557. "bits": [ 4483 ],
  188558. "attributes": {
  188559. "abc9_carry": "00000000000000000000000000000001",
  188560. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188561. }
  188562. },
  188563. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1": {
  188564. "hide_name": 0,
  188565. "bits": [ "0", 4461, 4462, 4463 ],
  188566. "attributes": {
  188567. "force_downto": "00000000000000000000000000000001",
  188568. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188569. }
  188570. },
  188571. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1": {
  188572. "hide_name": 0,
  188573. "bits": [ 4565, 4566, 4567, 4568 ],
  188574. "attributes": {
  188575. "force_downto": "00000000000000000000000000000001",
  188576. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188577. }
  188578. },
  188579. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3": {
  188580. "hide_name": 0,
  188581. "bits": [ 4572 ],
  188582. "attributes": {
  188583. "abc9_carry": "00000000000000000000000000000001",
  188584. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188585. }
  188586. },
  188587. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  188588. "hide_name": 0,
  188589. "bits": [ 4573 ],
  188590. "attributes": {
  188591. "abc9_carry": "00000000000000000000000000000001",
  188592. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188593. }
  188594. },
  188595. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188596. "hide_name": 0,
  188597. "bits": [ 4575 ],
  188598. "attributes": {
  188599. "abc9_carry": "00000000000000000000000000000001",
  188600. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188601. }
  188602. },
  188603. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188604. "hide_name": 0,
  188605. "bits": [ 4577 ],
  188606. "attributes": {
  188607. "abc9_carry": "00000000000000000000000000000001",
  188608. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188609. }
  188610. },
  188611. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188612. "hide_name": 0,
  188613. "bits": [ 4579 ],
  188614. "attributes": {
  188615. "abc9_carry": "00000000000000000000000000000001",
  188616. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188617. }
  188618. },
  188619. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188620. "hide_name": 0,
  188621. "bits": [ 4581 ],
  188622. "attributes": {
  188623. "abc9_carry": "00000000000000000000000000000001",
  188624. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188625. }
  188626. },
  188627. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188628. "hide_name": 0,
  188629. "bits": [ 4583 ],
  188630. "attributes": {
  188631. "abc9_carry": "00000000000000000000000000000001",
  188632. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188633. }
  188634. },
  188635. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188636. "hide_name": 0,
  188637. "bits": [ 4585 ],
  188638. "attributes": {
  188639. "abc9_carry": "00000000000000000000000000000001",
  188640. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188641. }
  188642. },
  188643. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188644. "hide_name": 0,
  188645. "bits": [ 4587 ],
  188646. "attributes": {
  188647. "abc9_carry": "00000000000000000000000000000001",
  188648. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188649. }
  188650. },
  188651. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188652. "hide_name": 0,
  188653. "bits": [ 4589 ],
  188654. "attributes": {
  188655. "abc9_carry": "00000000000000000000000000000001",
  188656. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188657. }
  188658. },
  188659. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188660. "hide_name": 0,
  188661. "bits": [ 4591 ],
  188662. "attributes": {
  188663. "abc9_carry": "00000000000000000000000000000001",
  188664. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188665. }
  188666. },
  188667. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188668. "hide_name": 0,
  188669. "bits": [ 4494 ],
  188670. "attributes": {
  188671. "abc9_carry": "00000000000000000000000000000001",
  188672. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188673. }
  188674. },
  188675. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188676. "hide_name": 0,
  188677. "bits": [ "0", 4493, "0", 4494 ],
  188678. "attributes": {
  188679. "force_downto": "00000000000000000000000000000001",
  188680. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188681. }
  188682. },
  188683. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188684. "hide_name": 0,
  188685. "bits": [ "0", 4592, "0", 4591 ],
  188686. "attributes": {
  188687. "force_downto": "00000000000000000000000000000001",
  188688. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188689. }
  188690. },
  188691. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188692. "hide_name": 0,
  188693. "bits": [ "0", 4590, "0", 4589 ],
  188694. "attributes": {
  188695. "force_downto": "00000000000000000000000000000001",
  188696. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188697. }
  188698. },
  188699. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188700. "hide_name": 0,
  188701. "bits": [ "0", 4588, "0", 4587 ],
  188702. "attributes": {
  188703. "force_downto": "00000000000000000000000000000001",
  188704. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188705. }
  188706. },
  188707. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188708. "hide_name": 0,
  188709. "bits": [ "0", 4586, "0", 4585 ],
  188710. "attributes": {
  188711. "force_downto": "00000000000000000000000000000001",
  188712. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188713. }
  188714. },
  188715. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188716. "hide_name": 0,
  188717. "bits": [ "0", 4584, "0", 4583 ],
  188718. "attributes": {
  188719. "force_downto": "00000000000000000000000000000001",
  188720. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188721. }
  188722. },
  188723. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188724. "hide_name": 0,
  188725. "bits": [ "0", 4582, "0", 4581 ],
  188726. "attributes": {
  188727. "force_downto": "00000000000000000000000000000001",
  188728. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188729. }
  188730. },
  188731. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188732. "hide_name": 0,
  188733. "bits": [ "0", 4580, "0", 4579 ],
  188734. "attributes": {
  188735. "force_downto": "00000000000000000000000000000001",
  188736. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188737. }
  188738. },
  188739. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188740. "hide_name": 0,
  188741. "bits": [ "0", 4578, "0", 4577 ],
  188742. "attributes": {
  188743. "force_downto": "00000000000000000000000000000001",
  188744. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188745. }
  188746. },
  188747. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188748. "hide_name": 0,
  188749. "bits": [ "0", 4576, "0", 4575 ],
  188750. "attributes": {
  188751. "force_downto": "00000000000000000000000000000001",
  188752. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188753. }
  188754. },
  188755. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0": {
  188756. "hide_name": 0,
  188757. "bits": [ "0", 4574, "0", 4573 ],
  188758. "attributes": {
  188759. "force_downto": "00000000000000000000000000000001",
  188760. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188761. }
  188762. },
  188763. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3": {
  188764. "hide_name": 0,
  188765. "bits": [ 4568 ],
  188766. "attributes": {
  188767. "abc9_carry": "00000000000000000000000000000001",
  188768. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188769. }
  188770. },
  188771. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  188772. "hide_name": 0,
  188773. "bits": [ 4593 ],
  188774. "attributes": {
  188775. "abc9_carry": "00000000000000000000000000000001",
  188776. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188777. }
  188778. },
  188779. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188780. "hide_name": 0,
  188781. "bits": [ 4595 ],
  188782. "attributes": {
  188783. "abc9_carry": "00000000000000000000000000000001",
  188784. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188785. }
  188786. },
  188787. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188788. "hide_name": 0,
  188789. "bits": [ 4597 ],
  188790. "attributes": {
  188791. "abc9_carry": "00000000000000000000000000000001",
  188792. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188793. }
  188794. },
  188795. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188796. "hide_name": 0,
  188797. "bits": [ 4599 ],
  188798. "attributes": {
  188799. "abc9_carry": "00000000000000000000000000000001",
  188800. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188801. }
  188802. },
  188803. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188804. "hide_name": 0,
  188805. "bits": [ 4601 ],
  188806. "attributes": {
  188807. "abc9_carry": "00000000000000000000000000000001",
  188808. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188809. }
  188810. },
  188811. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188812. "hide_name": 0,
  188813. "bits": [ 4603 ],
  188814. "attributes": {
  188815. "abc9_carry": "00000000000000000000000000000001",
  188816. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188817. }
  188818. },
  188819. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188820. "hide_name": 0,
  188821. "bits": [ 4605 ],
  188822. "attributes": {
  188823. "abc9_carry": "00000000000000000000000000000001",
  188824. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188825. }
  188826. },
  188827. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188828. "hide_name": 0,
  188829. "bits": [ 4607 ],
  188830. "attributes": {
  188831. "abc9_carry": "00000000000000000000000000000001",
  188832. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188833. }
  188834. },
  188835. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188836. "hide_name": 0,
  188837. "bits": [ 4609 ],
  188838. "attributes": {
  188839. "abc9_carry": "00000000000000000000000000000001",
  188840. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188841. }
  188842. },
  188843. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188844. "hide_name": 0,
  188845. "bits": [ 4611 ],
  188846. "attributes": {
  188847. "abc9_carry": "00000000000000000000000000000001",
  188848. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188849. }
  188850. },
  188851. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188852. "hide_name": 0,
  188853. "bits": [ 4613 ],
  188854. "attributes": {
  188855. "abc9_carry": "00000000000000000000000000000001",
  188856. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188857. }
  188858. },
  188859. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  188860. "hide_name": 0,
  188861. "bits": [ 4482 ],
  188862. "attributes": {
  188863. "abc9_carry": "00000000000000000000000000000001",
  188864. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  188865. }
  188866. },
  188867. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188868. "hide_name": 0,
  188869. "bits": [ "0", 4481, "0", 4482 ],
  188870. "attributes": {
  188871. "force_downto": "00000000000000000000000000000001",
  188872. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188873. }
  188874. },
  188875. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188876. "hide_name": 0,
  188877. "bits": [ "0", 4614, "0", 4613 ],
  188878. "attributes": {
  188879. "force_downto": "00000000000000000000000000000001",
  188880. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188881. }
  188882. },
  188883. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188884. "hide_name": 0,
  188885. "bits": [ "0", 4612, "0", 4611 ],
  188886. "attributes": {
  188887. "force_downto": "00000000000000000000000000000001",
  188888. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188889. }
  188890. },
  188891. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188892. "hide_name": 0,
  188893. "bits": [ 4490, 4491, 4492 ],
  188894. "attributes": {
  188895. "force_downto": "00000000000000000000000000000001",
  188896. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188897. }
  188898. },
  188899. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188900. "hide_name": 0,
  188901. "bits": [ "0", 4610, "0", 4609 ],
  188902. "attributes": {
  188903. "force_downto": "00000000000000000000000000000001",
  188904. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188905. }
  188906. },
  188907. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188908. "hide_name": 0,
  188909. "bits": [ 4499, 4500, 4501 ],
  188910. "attributes": {
  188911. "force_downto": "00000000000000000000000000000001",
  188912. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188913. }
  188914. },
  188915. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188916. "hide_name": 0,
  188917. "bits": [ "0", 4608, "0", 4607 ],
  188918. "attributes": {
  188919. "force_downto": "00000000000000000000000000000001",
  188920. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188921. }
  188922. },
  188923. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188924. "hide_name": 0,
  188925. "bits": [ 4506, 4507, 4508 ],
  188926. "attributes": {
  188927. "force_downto": "00000000000000000000000000000001",
  188928. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188929. }
  188930. },
  188931. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188932. "hide_name": 0,
  188933. "bits": [ "0", 4606, "0", 4605 ],
  188934. "attributes": {
  188935. "force_downto": "00000000000000000000000000000001",
  188936. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188937. }
  188938. },
  188939. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188940. "hide_name": 0,
  188941. "bits": [ 4513, 4514, 4515 ],
  188942. "attributes": {
  188943. "force_downto": "00000000000000000000000000000001",
  188944. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188945. }
  188946. },
  188947. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188948. "hide_name": 0,
  188949. "bits": [ "0", 4604, "0", 4603 ],
  188950. "attributes": {
  188951. "force_downto": "00000000000000000000000000000001",
  188952. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188953. }
  188954. },
  188955. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188956. "hide_name": 0,
  188957. "bits": [ 4616, 4615, 4617 ],
  188958. "attributes": {
  188959. "force_downto": "00000000000000000000000000000001",
  188960. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188961. }
  188962. },
  188963. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188964. "hide_name": 0,
  188965. "bits": [ "0", 4602, "0", 4601 ],
  188966. "attributes": {
  188967. "force_downto": "00000000000000000000000000000001",
  188968. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188969. }
  188970. },
  188971. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188972. "hide_name": 0,
  188973. "bits": [ 4619, 4618, 4620 ],
  188974. "attributes": {
  188975. "force_downto": "00000000000000000000000000000001",
  188976. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188977. }
  188978. },
  188979. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188980. "hide_name": 0,
  188981. "bits": [ "0", 4600, "0", 4599 ],
  188982. "attributes": {
  188983. "force_downto": "00000000000000000000000000000001",
  188984. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188985. }
  188986. },
  188987. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  188988. "hide_name": 0,
  188989. "bits": [ 4622, 4621, 4623 ],
  188990. "attributes": {
  188991. "force_downto": "00000000000000000000000000000001",
  188992. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  188993. }
  188994. },
  188995. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  188996. "hide_name": 0,
  188997. "bits": [ "0", 4598, "0", 4597 ],
  188998. "attributes": {
  188999. "force_downto": "00000000000000000000000000000001",
  189000. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189001. }
  189002. },
  189003. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  189004. "hide_name": 0,
  189005. "bits": [ 4625, 4624, 4626 ],
  189006. "attributes": {
  189007. "force_downto": "00000000000000000000000000000001",
  189008. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189009. }
  189010. },
  189011. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0": {
  189012. "hide_name": 0,
  189013. "bits": [ "0", 4596, "0", 4595 ],
  189014. "attributes": {
  189015. "force_downto": "00000000000000000000000000000001",
  189016. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189017. }
  189018. },
  189019. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  189020. "hide_name": 0,
  189021. "bits": [ 4628, 4627, 4629 ],
  189022. "attributes": {
  189023. "force_downto": "00000000000000000000000000000001",
  189024. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189025. }
  189026. },
  189027. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0": {
  189028. "hide_name": 0,
  189029. "bits": [ "0", 4594, "0", 4593 ],
  189030. "attributes": {
  189031. "force_downto": "00000000000000000000000000000001",
  189032. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189033. }
  189034. },
  189035. "cpu_I.execute_MUL_HH_SB_LUT4_O_I1_SB_LUT4_O_I3_SB_CARRY_CO_I0_SB_LUT4_I1_O": {
  189036. "hide_name": 0,
  189037. "bits": [ 4569, 4570, 4571 ],
  189038. "attributes": {
  189039. "force_downto": "00000000000000000000000000000001",
  189040. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189041. }
  189042. },
  189043. "cpu_I.execute_MUL_HH_SB_LUT4_O_I3": {
  189044. "hide_name": 0,
  189045. "bits": [ 4463 ],
  189046. "attributes": {
  189047. "abc9_carry": "00000000000000000000000000000001",
  189048. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189049. }
  189050. },
  189051. "cpu_I.execute_MUL_HL": {
  189052. "hide_name": 0,
  189053. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 4694, 4639, 4645, 4649, 4653, 4657, 4635, 4661, 4665, 4669, 4673, 4677, 4681, 4685, 4689, 4693, 4631, 4631 ],
  189054. "attributes": {
  189055. "hdlname": "cpu_I execute_MUL_HL",
  189056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:709.23-709.37"
  189057. }
  189058. },
  189059. "cpu_I.execute_MUL_HL_SB_LUT4_O_10_I2": {
  189060. "hide_name": 0,
  189061. "bits": [ "0", 4636, 4637, 4638 ],
  189062. "attributes": {
  189063. "force_downto": "00000000000000000000000000000001",
  189064. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189065. }
  189066. },
  189067. "cpu_I.execute_MUL_HL_SB_LUT4_O_10_I3": {
  189068. "hide_name": 0,
  189069. "bits": [ 4638 ],
  189070. "attributes": {
  189071. "abc9_carry": "00000000000000000000000000000001",
  189072. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189073. }
  189074. },
  189075. "cpu_I.execute_MUL_HL_SB_LUT4_O_11_I2": {
  189076. "hide_name": 0,
  189077. "bits": [ "0", 4642, 4643, 4644 ],
  189078. "attributes": {
  189079. "force_downto": "00000000000000000000000000000001",
  189080. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189081. }
  189082. },
  189083. "cpu_I.execute_MUL_HL_SB_LUT4_O_11_I3": {
  189084. "hide_name": 0,
  189085. "bits": [ 4644 ],
  189086. "attributes": {
  189087. "abc9_carry": "00000000000000000000000000000001",
  189088. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189089. }
  189090. },
  189091. "cpu_I.execute_MUL_HL_SB_LUT4_O_12_I2": {
  189092. "hide_name": 0,
  189093. "bits": [ "0", 4646, 4647, 4648 ],
  189094. "attributes": {
  189095. "force_downto": "00000000000000000000000000000001",
  189096. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189097. }
  189098. },
  189099. "cpu_I.execute_MUL_HL_SB_LUT4_O_12_I3": {
  189100. "hide_name": 0,
  189101. "bits": [ 4648 ],
  189102. "attributes": {
  189103. "abc9_carry": "00000000000000000000000000000001",
  189104. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189105. }
  189106. },
  189107. "cpu_I.execute_MUL_HL_SB_LUT4_O_13_I2": {
  189108. "hide_name": 0,
  189109. "bits": [ "0", 4650, 4651, 4652 ],
  189110. "attributes": {
  189111. "force_downto": "00000000000000000000000000000001",
  189112. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189113. }
  189114. },
  189115. "cpu_I.execute_MUL_HL_SB_LUT4_O_13_I3": {
  189116. "hide_name": 0,
  189117. "bits": [ 4652 ],
  189118. "attributes": {
  189119. "abc9_carry": "00000000000000000000000000000001",
  189120. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189121. }
  189122. },
  189123. "cpu_I.execute_MUL_HL_SB_LUT4_O_14_I2": {
  189124. "hide_name": 0,
  189125. "bits": [ "0", 4654, 4655, 4656 ],
  189126. "attributes": {
  189127. "force_downto": "00000000000000000000000000000001",
  189128. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189129. }
  189130. },
  189131. "cpu_I.execute_MUL_HL_SB_LUT4_O_14_I3": {
  189132. "hide_name": 0,
  189133. "bits": [ 4656 ],
  189134. "attributes": {
  189135. "abc9_carry": "00000000000000000000000000000001",
  189136. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189137. }
  189138. },
  189139. "cpu_I.execute_MUL_HL_SB_LUT4_O_15_I2": {
  189140. "hide_name": 0,
  189141. "bits": [ "0", 4658, 4659, 4660 ],
  189142. "attributes": {
  189143. "force_downto": "00000000000000000000000000000001",
  189144. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189145. }
  189146. },
  189147. "cpu_I.execute_MUL_HL_SB_LUT4_O_15_I3": {
  189148. "hide_name": 0,
  189149. "bits": [ 4660 ],
  189150. "attributes": {
  189151. "abc9_carry": "00000000000000000000000000000001",
  189152. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189153. }
  189154. },
  189155. "cpu_I.execute_MUL_HL_SB_LUT4_O_16_I2": {
  189156. "hide_name": 0,
  189157. "bits": [ "0", 4662, 4663, 4664 ],
  189158. "attributes": {
  189159. "force_downto": "00000000000000000000000000000001",
  189160. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189161. }
  189162. },
  189163. "cpu_I.execute_MUL_HL_SB_LUT4_O_16_I3": {
  189164. "hide_name": 0,
  189165. "bits": [ 4664 ],
  189166. "attributes": {
  189167. "abc9_carry": "00000000000000000000000000000001",
  189168. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189169. }
  189170. },
  189171. "cpu_I.execute_MUL_HL_SB_LUT4_O_1_I2": {
  189172. "hide_name": 0,
  189173. "bits": [ "0", 4632, 4633, 4634 ],
  189174. "attributes": {
  189175. "force_downto": "00000000000000000000000000000001",
  189176. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189177. }
  189178. },
  189179. "cpu_I.execute_MUL_HL_SB_LUT4_O_1_I3": {
  189180. "hide_name": 0,
  189181. "bits": [ 4634 ],
  189182. "attributes": {
  189183. "abc9_carry": "00000000000000000000000000000001",
  189184. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189185. }
  189186. },
  189187. "cpu_I.execute_MUL_HL_SB_LUT4_O_2_I2": {
  189188. "hide_name": 0,
  189189. "bits": [ "0", 4666, 4667, 4668 ],
  189190. "attributes": {
  189191. "force_downto": "00000000000000000000000000000001",
  189192. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189193. }
  189194. },
  189195. "cpu_I.execute_MUL_HL_SB_LUT4_O_2_I3": {
  189196. "hide_name": 0,
  189197. "bits": [ 4668 ],
  189198. "attributes": {
  189199. "abc9_carry": "00000000000000000000000000000001",
  189200. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189201. }
  189202. },
  189203. "cpu_I.execute_MUL_HL_SB_LUT4_O_3_I2": {
  189204. "hide_name": 0,
  189205. "bits": [ "0", 4670, 4671, 4672 ],
  189206. "attributes": {
  189207. "force_downto": "00000000000000000000000000000001",
  189208. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189209. }
  189210. },
  189211. "cpu_I.execute_MUL_HL_SB_LUT4_O_3_I3": {
  189212. "hide_name": 0,
  189213. "bits": [ 4672 ],
  189214. "attributes": {
  189215. "abc9_carry": "00000000000000000000000000000001",
  189216. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189217. }
  189218. },
  189219. "cpu_I.execute_MUL_HL_SB_LUT4_O_4_I2": {
  189220. "hide_name": 0,
  189221. "bits": [ "0", 4674, 4675, 4676 ],
  189222. "attributes": {
  189223. "force_downto": "00000000000000000000000000000001",
  189224. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189225. }
  189226. },
  189227. "cpu_I.execute_MUL_HL_SB_LUT4_O_4_I3": {
  189228. "hide_name": 0,
  189229. "bits": [ 4676 ],
  189230. "attributes": {
  189231. "abc9_carry": "00000000000000000000000000000001",
  189232. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189233. }
  189234. },
  189235. "cpu_I.execute_MUL_HL_SB_LUT4_O_5_I2": {
  189236. "hide_name": 0,
  189237. "bits": [ "0", 4678, 4679, 4680 ],
  189238. "attributes": {
  189239. "force_downto": "00000000000000000000000000000001",
  189240. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189241. }
  189242. },
  189243. "cpu_I.execute_MUL_HL_SB_LUT4_O_5_I3": {
  189244. "hide_name": 0,
  189245. "bits": [ 4680 ],
  189246. "attributes": {
  189247. "abc9_carry": "00000000000000000000000000000001",
  189248. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189249. }
  189250. },
  189251. "cpu_I.execute_MUL_HL_SB_LUT4_O_6_I2": {
  189252. "hide_name": 0,
  189253. "bits": [ "0", 4682, 4683, 4684 ],
  189254. "attributes": {
  189255. "force_downto": "00000000000000000000000000000001",
  189256. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189257. }
  189258. },
  189259. "cpu_I.execute_MUL_HL_SB_LUT4_O_6_I3": {
  189260. "hide_name": 0,
  189261. "bits": [ 4684 ],
  189262. "attributes": {
  189263. "abc9_carry": "00000000000000000000000000000001",
  189264. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189265. }
  189266. },
  189267. "cpu_I.execute_MUL_HL_SB_LUT4_O_7_I2": {
  189268. "hide_name": 0,
  189269. "bits": [ "0", 4686, 4687, 4688 ],
  189270. "attributes": {
  189271. "force_downto": "00000000000000000000000000000001",
  189272. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189273. }
  189274. },
  189275. "cpu_I.execute_MUL_HL_SB_LUT4_O_7_I3": {
  189276. "hide_name": 0,
  189277. "bits": [ 4688 ],
  189278. "attributes": {
  189279. "abc9_carry": "00000000000000000000000000000001",
  189280. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189281. }
  189282. },
  189283. "cpu_I.execute_MUL_HL_SB_LUT4_O_8_I2": {
  189284. "hide_name": 0,
  189285. "bits": [ "0", 4690, 4691, 4692 ],
  189286. "attributes": {
  189287. "force_downto": "00000000000000000000000000000001",
  189288. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189289. }
  189290. },
  189291. "cpu_I.execute_MUL_HL_SB_LUT4_O_8_I3": {
  189292. "hide_name": 0,
  189293. "bits": [ 4692 ],
  189294. "attributes": {
  189295. "abc9_carry": "00000000000000000000000000000001",
  189296. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189297. }
  189298. },
  189299. "cpu_I.execute_MUL_HL_SB_LUT4_O_9_I3": {
  189300. "hide_name": 0,
  189301. "bits": [ 4640 ],
  189302. "attributes": {
  189303. "abc9_carry": "00000000000000000000000000000001",
  189304. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  189305. }
  189306. },
  189307. "cpu_I.execute_MUL_HL_SB_LUT4_O_I2": {
  189308. "hide_name": 0,
  189309. "bits": [ 3661, 4521 ],
  189310. "attributes": {
  189311. "force_downto": "00000000000000000000000000000001",
  189312. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189313. }
  189314. },
  189315. "cpu_I.execute_MUL_HL_SB_LUT4_O_I3": {
  189316. "hide_name": 0,
  189317. "bits": [ 4630 ],
  189318. "attributes": {
  189319. "abc9_carry": "00000000000000000000000000000001",
  189320. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189321. }
  189322. },
  189323. "cpu_I.execute_MUL_LH": {
  189324. "hide_name": 0,
  189325. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 4758, 4759, 4704, 4711, 4715, 4719, 4723, 4727, 4731, 4700, 4735, 4739, 4743, 4747, 4751, 4755, 4696, 4696 ],
  189326. "attributes": {
  189327. "hdlname": "cpu_I execute_MUL_LH",
  189328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:673.23-673.37"
  189329. }
  189330. },
  189331. "cpu_I.execute_MUL_LH_SB_LUT4_O_10_I2": {
  189332. "hide_name": 0,
  189333. "bits": [ "0", 4701, 4702, 4703 ],
  189334. "attributes": {
  189335. "force_downto": "00000000000000000000000000000001",
  189336. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189337. }
  189338. },
  189339. "cpu_I.execute_MUL_LH_SB_LUT4_O_10_I3": {
  189340. "hide_name": 0,
  189341. "bits": [ 4703 ],
  189342. "attributes": {
  189343. "abc9_carry": "00000000000000000000000000000001",
  189344. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189345. }
  189346. },
  189347. "cpu_I.execute_MUL_LH_SB_LUT4_O_11_I2": {
  189348. "hide_name": 0,
  189349. "bits": [ "0", 4708, 4709, 4710 ],
  189350. "attributes": {
  189351. "force_downto": "00000000000000000000000000000001",
  189352. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189353. }
  189354. },
  189355. "cpu_I.execute_MUL_LH_SB_LUT4_O_11_I3": {
  189356. "hide_name": 0,
  189357. "bits": [ 4710 ],
  189358. "attributes": {
  189359. "abc9_carry": "00000000000000000000000000000001",
  189360. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189361. }
  189362. },
  189363. "cpu_I.execute_MUL_LH_SB_LUT4_O_12_I2": {
  189364. "hide_name": 0,
  189365. "bits": [ "0", 4712, 4713, 4714 ],
  189366. "attributes": {
  189367. "force_downto": "00000000000000000000000000000001",
  189368. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189369. }
  189370. },
  189371. "cpu_I.execute_MUL_LH_SB_LUT4_O_12_I3": {
  189372. "hide_name": 0,
  189373. "bits": [ 4714 ],
  189374. "attributes": {
  189375. "abc9_carry": "00000000000000000000000000000001",
  189376. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189377. }
  189378. },
  189379. "cpu_I.execute_MUL_LH_SB_LUT4_O_13_I2": {
  189380. "hide_name": 0,
  189381. "bits": [ "0", 4716, 4717, 4718 ],
  189382. "attributes": {
  189383. "force_downto": "00000000000000000000000000000001",
  189384. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189385. }
  189386. },
  189387. "cpu_I.execute_MUL_LH_SB_LUT4_O_13_I3": {
  189388. "hide_name": 0,
  189389. "bits": [ 4718 ],
  189390. "attributes": {
  189391. "abc9_carry": "00000000000000000000000000000001",
  189392. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189393. }
  189394. },
  189395. "cpu_I.execute_MUL_LH_SB_LUT4_O_14_I2": {
  189396. "hide_name": 0,
  189397. "bits": [ "0", 4720, 4721, 4722 ],
  189398. "attributes": {
  189399. "force_downto": "00000000000000000000000000000001",
  189400. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189401. }
  189402. },
  189403. "cpu_I.execute_MUL_LH_SB_LUT4_O_14_I3": {
  189404. "hide_name": 0,
  189405. "bits": [ 4722 ],
  189406. "attributes": {
  189407. "abc9_carry": "00000000000000000000000000000001",
  189408. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189409. }
  189410. },
  189411. "cpu_I.execute_MUL_LH_SB_LUT4_O_15_I2": {
  189412. "hide_name": 0,
  189413. "bits": [ "0", 4724, 4725, 4726 ],
  189414. "attributes": {
  189415. "force_downto": "00000000000000000000000000000001",
  189416. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189417. }
  189418. },
  189419. "cpu_I.execute_MUL_LH_SB_LUT4_O_15_I3": {
  189420. "hide_name": 0,
  189421. "bits": [ 4726 ],
  189422. "attributes": {
  189423. "abc9_carry": "00000000000000000000000000000001",
  189424. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189425. }
  189426. },
  189427. "cpu_I.execute_MUL_LH_SB_LUT4_O_16_I2": {
  189428. "hide_name": 0,
  189429. "bits": [ "0", 4728, 4729, 4730 ],
  189430. "attributes": {
  189431. "force_downto": "00000000000000000000000000000001",
  189432. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189433. }
  189434. },
  189435. "cpu_I.execute_MUL_LH_SB_LUT4_O_16_I3": {
  189436. "hide_name": 0,
  189437. "bits": [ 4730 ],
  189438. "attributes": {
  189439. "abc9_carry": "00000000000000000000000000000001",
  189440. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189441. }
  189442. },
  189443. "cpu_I.execute_MUL_LH_SB_LUT4_O_1_I2": {
  189444. "hide_name": 0,
  189445. "bits": [ "0", 4697, 4698, 4699 ],
  189446. "attributes": {
  189447. "force_downto": "00000000000000000000000000000001",
  189448. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189449. }
  189450. },
  189451. "cpu_I.execute_MUL_LH_SB_LUT4_O_1_I3": {
  189452. "hide_name": 0,
  189453. "bits": [ 4699 ],
  189454. "attributes": {
  189455. "abc9_carry": "00000000000000000000000000000001",
  189456. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189457. }
  189458. },
  189459. "cpu_I.execute_MUL_LH_SB_LUT4_O_2_I2": {
  189460. "hide_name": 0,
  189461. "bits": [ "0", 4732, 4733, 4734 ],
  189462. "attributes": {
  189463. "force_downto": "00000000000000000000000000000001",
  189464. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189465. }
  189466. },
  189467. "cpu_I.execute_MUL_LH_SB_LUT4_O_2_I3": {
  189468. "hide_name": 0,
  189469. "bits": [ 4734 ],
  189470. "attributes": {
  189471. "abc9_carry": "00000000000000000000000000000001",
  189472. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189473. }
  189474. },
  189475. "cpu_I.execute_MUL_LH_SB_LUT4_O_3_I2": {
  189476. "hide_name": 0,
  189477. "bits": [ "0", 4736, 4737, 4738 ],
  189478. "attributes": {
  189479. "force_downto": "00000000000000000000000000000001",
  189480. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189481. }
  189482. },
  189483. "cpu_I.execute_MUL_LH_SB_LUT4_O_3_I3": {
  189484. "hide_name": 0,
  189485. "bits": [ 4738 ],
  189486. "attributes": {
  189487. "abc9_carry": "00000000000000000000000000000001",
  189488. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189489. }
  189490. },
  189491. "cpu_I.execute_MUL_LH_SB_LUT4_O_4_I2": {
  189492. "hide_name": 0,
  189493. "bits": [ "0", 4740, 4741, 4742 ],
  189494. "attributes": {
  189495. "force_downto": "00000000000000000000000000000001",
  189496. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189497. }
  189498. },
  189499. "cpu_I.execute_MUL_LH_SB_LUT4_O_4_I3": {
  189500. "hide_name": 0,
  189501. "bits": [ 4742 ],
  189502. "attributes": {
  189503. "abc9_carry": "00000000000000000000000000000001",
  189504. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189505. }
  189506. },
  189507. "cpu_I.execute_MUL_LH_SB_LUT4_O_5_I2": {
  189508. "hide_name": 0,
  189509. "bits": [ "0", 4744, 4745, 4746 ],
  189510. "attributes": {
  189511. "force_downto": "00000000000000000000000000000001",
  189512. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189513. }
  189514. },
  189515. "cpu_I.execute_MUL_LH_SB_LUT4_O_5_I3": {
  189516. "hide_name": 0,
  189517. "bits": [ 4746 ],
  189518. "attributes": {
  189519. "abc9_carry": "00000000000000000000000000000001",
  189520. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189521. }
  189522. },
  189523. "cpu_I.execute_MUL_LH_SB_LUT4_O_6_I2": {
  189524. "hide_name": 0,
  189525. "bits": [ "0", 4748, 4749, 4750 ],
  189526. "attributes": {
  189527. "force_downto": "00000000000000000000000000000001",
  189528. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189529. }
  189530. },
  189531. "cpu_I.execute_MUL_LH_SB_LUT4_O_6_I3": {
  189532. "hide_name": 0,
  189533. "bits": [ 4750 ],
  189534. "attributes": {
  189535. "abc9_carry": "00000000000000000000000000000001",
  189536. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189537. }
  189538. },
  189539. "cpu_I.execute_MUL_LH_SB_LUT4_O_7_I2": {
  189540. "hide_name": 0,
  189541. "bits": [ "0", 4752, 4753, 4754 ],
  189542. "attributes": {
  189543. "force_downto": "00000000000000000000000000000001",
  189544. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189545. }
  189546. },
  189547. "cpu_I.execute_MUL_LH_SB_LUT4_O_7_I3": {
  189548. "hide_name": 0,
  189549. "bits": [ 4754 ],
  189550. "attributes": {
  189551. "abc9_carry": "00000000000000000000000000000001",
  189552. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189553. }
  189554. },
  189555. "cpu_I.execute_MUL_LH_SB_LUT4_O_8_I2": {
  189556. "hide_name": 0,
  189557. "bits": [ "0", 4756, 4757, 4303 ],
  189558. "attributes": {
  189559. "force_downto": "00000000000000000000000000000001",
  189560. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189561. }
  189562. },
  189563. "cpu_I.execute_MUL_LH_SB_LUT4_O_9_I2": {
  189564. "hide_name": 0,
  189565. "bits": [ "0", 4706, 4707, 4705 ],
  189566. "attributes": {
  189567. "force_downto": "00000000000000000000000000000001",
  189568. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189569. }
  189570. },
  189571. "cpu_I.execute_MUL_LH_SB_LUT4_O_9_I3": {
  189572. "hide_name": 0,
  189573. "bits": [ 4705 ],
  189574. "attributes": {
  189575. "abc9_carry": "00000000000000000000000000000001",
  189576. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189577. }
  189578. },
  189579. "cpu_I.execute_MUL_LH_SB_LUT4_O_I3": {
  189580. "hide_name": 0,
  189581. "bits": [ 4695 ],
  189582. "attributes": {
  189583. "abc9_carry": "00000000000000000000000000000001",
  189584. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189585. }
  189586. },
  189587. "cpu_I.execute_MulPlugin_a": {
  189588. "hide_name": 0,
  189589. "bits": [ 2842, 2770, 2759, 2848, 4120, 4115, 4110, 2846, 4099, 4047, 4098, 2852, 4089, 4084, 4079, 4074, 4069, 4064, 4059, 4054, 2851, 4038, 4033, 4028, 2845, 4019, 4014, 4009, 2849, 2756, 2771, 2843 ],
  189590. "attributes": {
  189591. "hdlname": "cpu_I execute_MulPlugin_a",
  189592. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1207.23-1207.42"
  189593. }
  189594. },
  189595. "cpu_I.execute_MulPlugin_aHigh": {
  189596. "hide_name": 0,
  189597. "bits": [ 4069, 4064, 4059, 4054, 2851, 4038, 4033, 4028, 2845, 4019, 4014, 4009, 2849, 2756, 2771, 2843, 7152 ],
  189598. "attributes": {
  189599. "hdlname": "cpu_I execute_MulPlugin_aHigh",
  189600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1213.23-1213.46",
  189601. "unused_bits": "16"
  189602. }
  189603. },
  189604. "cpu_I.execute_MulPlugin_aSLow": {
  189605. "hide_name": 0,
  189606. "bits": [ 2842, 2770, 2759, 2848, 4120, 4115, 4110, 2846, 4099, 4047, 4098, 2852, 4089, 4084, 4079, 4074, "0" ],
  189607. "attributes": {
  189608. "hdlname": "cpu_I execute_MulPlugin_aSLow",
  189609. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1211.23-1211.46"
  189610. }
  189611. },
  189612. "cpu_I.execute_MulPlugin_aULow": {
  189613. "hide_name": 0,
  189614. "bits": [ 2842, 2770, 2759, 2848, 4120, 4115, 4110, 2846, 4099, 4047, 4098, 2852, 4089, 4084, 4079, 4074 ],
  189615. "attributes": {
  189616. "hdlname": "cpu_I execute_MulPlugin_aULow",
  189617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1209.23-1209.46"
  189618. }
  189619. },
  189620. "cpu_I.execute_MulPlugin_b": {
  189621. "hide_name": 0,
  189622. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3061, 3641, 3076, 2870, 2882, 3657, 2898, 3664, 2913, 3676, 3674, 3672, 2934, 3668, 3666, 2954, 3684, 3016, 3643, 3647, 2996, 3654, 3658, 3661 ],
  189623. "attributes": {
  189624. "hdlname": "cpu_I execute_MulPlugin_b",
  189625. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1208.23-1208.42"
  189626. }
  189627. },
  189628. "cpu_I.execute_MulPlugin_bHigh": {
  189629. "hide_name": 0,
  189630. "bits": [ 2913, 3676, 3674, 3672, 2934, 3668, 3666, 2954, 3684, 3016, 3643, 3647, 2996, 3654, 3658, 3661, 7153 ],
  189631. "attributes": {
  189632. "hdlname": "cpu_I execute_MulPlugin_bHigh",
  189633. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1214.23-1214.46",
  189634. "unused_bits": "16"
  189635. }
  189636. },
  189637. "cpu_I.execute_MulPlugin_bSLow": {
  189638. "hide_name": 0,
  189639. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3061, 3641, 3076, 2870, 2882, 3657, 2898, 3664, "0" ],
  189640. "attributes": {
  189641. "hdlname": "cpu_I execute_MulPlugin_bSLow",
  189642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1212.23-1212.46"
  189643. }
  189644. },
  189645. "cpu_I.execute_MulPlugin_bULow": {
  189646. "hide_name": 0,
  189647. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3061, 3641, 3076, 2870, 2882, 3657, 2898, 3664 ],
  189648. "attributes": {
  189649. "hdlname": "cpu_I execute_MulPlugin_bULow",
  189650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1210.23-1210.46"
  189651. }
  189652. },
  189653. "cpu_I.execute_PC": {
  189654. "hide_name": 0,
  189655. "bits": [ "0", "0", 4261, 4260, 4259, 3014, 3034, 3045, 3059, 4258, 3074, 2867, 2880, 4256, 2896, 4255, 2911, 4254, 4253, 4252, 2932, 4251, 4266, 2952, 4265, 4264, 4263, 4262, 2994, 4257, 4250, 4249 ],
  189656. "attributes": {
  189657. "hdlname": "cpu_I execute_PC",
  189658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:759.23-759.33"
  189659. }
  189660. },
  189661. "cpu_I.execute_PREDICTION_HAD_BRANCHED2": {
  189662. "hide_name": 0,
  189663. "bits": [ 4267 ],
  189664. "attributes": {
  189665. "hdlname": "cpu_I execute_PREDICTION_HAD_BRANCHED2",
  189666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:760.23-760.55"
  189667. }
  189668. },
  189669. "cpu_I.execute_REGFILE_WRITE_VALID": {
  189670. "hide_name": 0,
  189671. "bits": [ 4268 ],
  189672. "attributes": {
  189673. "hdlname": "cpu_I execute_REGFILE_WRITE_VALID",
  189674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:768.23-768.50"
  189675. }
  189676. },
  189677. "cpu_I.execute_RS1": {
  189678. "hide_name": 0,
  189679. "bits": [ 2842, 2770, 2759, 2848, 4120, 4115, 4110, 2846, 4099, 4047, 4098, 2852, 4089, 4084, 4079, 4074, 4069, 4064, 4059, 4054, 2851, 4038, 4033, 4028, 2845, 4019, 4014, 4009, 2849, 2756, 2771, 2843 ],
  189680. "attributes": {
  189681. "hdlname": "cpu_I execute_RS1",
  189682. "keep": "00000000000000000000000000000001",
  189683. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:761.45-761.56",
  189684. "syn_keep": "00000000000000000000000000000001"
  189685. }
  189686. },
  189687. "cpu_I.execute_RS2": {
  189688. "hide_name": 0,
  189689. "bits": [ 3639, 2535, 3646, 3650, 3653, 3022, 3036, 3047, 3061, 3641, 3076, 2870, 2882, 3657, 2898, 3664, 2913, 3676, 3674, 3672, 2934, 3668, 3666, 2954, 3684, 3016, 3643, 3647, 2996, 3654, 3658, 3661 ],
  189690. "attributes": {
  189691. "hdlname": "cpu_I execute_RS2",
  189692. "keep": "00000000000000000000000000000001",
  189693. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:838.45-838.56",
  189694. "syn_keep": "00000000000000000000000000000001"
  189695. }
  189696. },
  189697. "cpu_I.execute_SHIFT_CTRL": {
  189698. "hide_name": 0,
  189699. "bits": [ 4278, 4277 ],
  189700. "attributes": {
  189701. "hdlname": "cpu_I execute_SHIFT_CTRL",
  189702. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:780.20-780.38"
  189703. }
  189704. },
  189705. "cpu_I.execute_SHIFT_RIGHT": {
  189706. "hide_name": 0,
  189707. "bits": [ 2348, 2444, 2352, 2430, 2476, 2514, 2548, 2556, 2559, 2568, 2571, 2355, 2483, 2358, 2478, 2402, 2448, 2447, 2446, 2445, 2440, 2438, 2436, 2434, 2432, 2427, 2425, 2418, 2417, 2414, 2413, 2409 ],
  189708. "attributes": {
  189709. "hdlname": "cpu_I execute_SHIFT_RIGHT",
  189710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:725.23-725.42"
  189711. }
  189712. },
  189713. "cpu_I.execute_SRC1_CTRL": {
  189714. "hide_name": 0,
  189715. "bits": [ 2758, 2757 ],
  189716. "attributes": {
  189717. "hdlname": "cpu_I execute_SRC1_CTRL",
  189718. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:788.20-788.37"
  189719. }
  189720. },
  189721. "cpu_I.execute_SRC2_CTRL": {
  189722. "hide_name": 0,
  189723. "bits": [ 2872, 2871 ],
  189724. "attributes": {
  189725. "hdlname": "cpu_I execute_SRC2_CTRL",
  189726. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:786.20-786.37"
  189727. }
  189728. },
  189729. "cpu_I.execute_SRC2_FORCE_ZERO": {
  189730. "hide_name": 0,
  189731. "bits": [ 1254 ],
  189732. "attributes": {
  189733. "hdlname": "cpu_I execute_SRC2_FORCE_ZERO",
  189734. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:783.23-783.46"
  189735. }
  189736. },
  189737. "cpu_I.execute_SRC_ADD": {
  189738. "hide_name": 0,
  189739. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  189740. "attributes": {
  189741. "hdlname": "cpu_I execute_SRC_ADD",
  189742. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:837.23-837.38",
  189743. "unused_bits": "28 29"
  189744. }
  189745. },
  189746. "cpu_I.execute_SRC_ADD_SUB": {
  189747. "hide_name": 0,
  189748. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  189749. "attributes": {
  189750. "hdlname": "cpu_I execute_SRC_ADD_SUB",
  189751. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:792.23-792.42",
  189752. "unused_bits": "28 29"
  189753. }
  189754. },
  189755. "cpu_I.execute_SRC_LESS_UNSIGNED": {
  189756. "hide_name": 0,
  189757. "bits": [ 4279 ],
  189758. "attributes": {
  189759. "hdlname": "cpu_I execute_SRC_LESS_UNSIGNED",
  189760. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:782.23-782.48"
  189761. }
  189762. },
  189763. "cpu_I.execute_SRC_USE_SUB_LESS": {
  189764. "hide_name": 0,
  189765. "bits": [ 2991 ],
  189766. "attributes": {
  189767. "hdlname": "cpu_I execute_SRC_USE_SUB_LESS",
  189768. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:784.23-784.47"
  189769. }
  189770. },
  189771. "cpu_I.execute_SrcPlugin_addSub": {
  189772. "hide_name": 0,
  189773. "bits": [ 2775, 3078, 2761, 2973, 3000, 3007, 3029, 3040, 3054, 3696, 3071, 2865, 2877, 3694, 2892, 3693, 2908, 3692, 3691, 3690, 2929, 3703, 3702, 2949, 3701, 3700, 3699, 3695, 6997, 6998, 3689, 1244 ],
  189774. "attributes": {
  189775. "hdlname": "cpu_I execute_SrcPlugin_addSub",
  189776. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1105.23-1105.47",
  189777. "unused_bits": "28 29"
  189778. }
  189779. },
  189780. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I1": {
  189781. "hide_name": 0,
  189782. "bits": [ 2378, 2521, 2522 ],
  189783. "attributes": {
  189784. "force_downto": "00000000000000000000000000000001",
  189785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189786. }
  189787. },
  189788. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2": {
  189789. "hide_name": 0,
  189790. "bits": [ 1254, 2521, 4764, 4765 ],
  189791. "attributes": {
  189792. "force_downto": "00000000000000000000000000000001",
  189793. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189794. }
  189795. },
  189796. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3": {
  189797. "hide_name": 0,
  189798. "bits": [ 2991, 4766 ],
  189799. "attributes": {
  189800. "force_downto": "00000000000000000000000000000001",
  189801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189802. }
  189803. },
  189804. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  189805. "hide_name": 0,
  189806. "bits": [ 1246, 1247, 4767, 3690 ],
  189807. "attributes": {
  189808. "force_downto": "00000000000000000000000000000001",
  189809. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189810. }
  189811. },
  189812. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  189813. "hide_name": 0,
  189814. "bits": [ 2858, 2920, 2921 ],
  189815. "attributes": {
  189816. "force_downto": "00000000000000000000000000000001",
  189817. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189818. }
  189819. },
  189820. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  189821. "hide_name": 0,
  189822. "bits": [ 1158, 1034, 4768 ],
  189823. "attributes": {
  189824. "force_downto": "00000000000000000000000000000001",
  189825. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189826. }
  189827. },
  189828. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  189829. "hide_name": 0,
  189830. "bits": [ 1072, 1037, 1043, 4769 ],
  189831. "attributes": {
  189832. "force_downto": "00000000000000000000000000000001",
  189833. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189834. }
  189835. },
  189836. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  189837. "hide_name": 0,
  189838. "bits": [ 4252, 2868, 4770 ],
  189839. "attributes": {
  189840. "force_downto": "00000000000000000000000000000001",
  189841. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189842. }
  189843. },
  189844. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_10_I3": {
  189845. "hide_name": 0,
  189846. "bits": [ 4765 ],
  189847. "attributes": {
  189848. "abc9_carry": "00000000000000000000000000000001",
  189849. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189850. }
  189851. },
  189852. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_11_I2": {
  189853. "hide_name": 0,
  189854. "bits": [ 1254, 2398, 4773, 4774 ],
  189855. "attributes": {
  189856. "force_downto": "00000000000000000000000000000001",
  189857. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189858. }
  189859. },
  189860. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_11_I3": {
  189861. "hide_name": 0,
  189862. "bits": [ 4774 ],
  189863. "attributes": {
  189864. "abc9_carry": "00000000000000000000000000000001",
  189865. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189866. }
  189867. },
  189868. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2": {
  189869. "hide_name": 0,
  189870. "bits": [ 1254, 2396, 4775, 4776 ],
  189871. "attributes": {
  189872. "force_downto": "00000000000000000000000000000001",
  189873. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189874. }
  189875. },
  189876. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3": {
  189877. "hide_name": 0,
  189878. "bits": [ 966, 1250, 2396, 4777 ],
  189879. "attributes": {
  189880. "force_downto": "00000000000000000000000000000001",
  189881. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189882. }
  189883. },
  189884. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  189885. "hide_name": 0,
  189886. "bits": [ 1246, 1247, 4779, 3703 ],
  189887. "attributes": {
  189888. "force_downto": "00000000000000000000000000000001",
  189889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189890. }
  189891. },
  189892. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  189893. "hide_name": 0,
  189894. "bits": [ 2858, 2937, 2938 ],
  189895. "attributes": {
  189896. "force_downto": "00000000000000000000000000000001",
  189897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189898. }
  189899. },
  189900. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  189901. "hide_name": 0,
  189902. "bits": [ 1156, 1034, 4780 ],
  189903. "attributes": {
  189904. "force_downto": "00000000000000000000000000000001",
  189905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189906. }
  189907. },
  189908. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  189909. "hide_name": 0,
  189910. "bits": [ 1068, 1037, 1043, 4781 ],
  189911. "attributes": {
  189912. "force_downto": "00000000000000000000000000000001",
  189913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189914. }
  189915. },
  189916. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  189917. "hide_name": 0,
  189918. "bits": [ 4251, 2868, 4782 ],
  189919. "attributes": {
  189920. "force_downto": "00000000000000000000000000000001",
  189921. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189922. }
  189923. },
  189924. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_12_I3": {
  189925. "hide_name": 0,
  189926. "bits": [ 4776 ],
  189927. "attributes": {
  189928. "abc9_carry": "00000000000000000000000000000001",
  189929. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189930. }
  189931. },
  189932. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2": {
  189933. "hide_name": 0,
  189934. "bits": [ 1254, 2394, 4783, 4784 ],
  189935. "attributes": {
  189936. "force_downto": "00000000000000000000000000000001",
  189937. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189938. }
  189939. },
  189940. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3": {
  189941. "hide_name": 0,
  189942. "bits": [ 2991, 4785 ],
  189943. "attributes": {
  189944. "force_downto": "00000000000000000000000000000001",
  189945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189946. }
  189947. },
  189948. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  189949. "hide_name": 0,
  189950. "bits": [ 1246, 1247, 4786, 3702 ],
  189951. "attributes": {
  189952. "force_downto": "00000000000000000000000000000001",
  189953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189954. }
  189955. },
  189956. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  189957. "hide_name": 0,
  189958. "bits": [ 2858, 2940, 2941 ],
  189959. "attributes": {
  189960. "force_downto": "00000000000000000000000000000001",
  189961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189962. }
  189963. },
  189964. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  189965. "hide_name": 0,
  189966. "bits": [ 1182, 1034, 4787 ],
  189967. "attributes": {
  189968. "force_downto": "00000000000000000000000000000001",
  189969. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189970. }
  189971. },
  189972. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  189973. "hide_name": 0,
  189974. "bits": [ 1125, 1037, 1043, 4788 ],
  189975. "attributes": {
  189976. "force_downto": "00000000000000000000000000000001",
  189977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189978. }
  189979. },
  189980. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  189981. "hide_name": 0,
  189982. "bits": [ 4266, 2868, 4789 ],
  189983. "attributes": {
  189984. "force_downto": "00000000000000000000000000000001",
  189985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  189986. }
  189987. },
  189988. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_13_I3": {
  189989. "hide_name": 0,
  189990. "bits": [ 4784 ],
  189991. "attributes": {
  189992. "abc9_carry": "00000000000000000000000000000001",
  189993. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  189994. }
  189995. },
  189996. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_14_I2": {
  189997. "hide_name": 0,
  189998. "bits": [ 1254, 2392, 4790, 4791 ],
  189999. "attributes": {
  190000. "force_downto": "00000000000000000000000000000001",
  190001. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190002. }
  190003. },
  190004. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_14_I3": {
  190005. "hide_name": 0,
  190006. "bits": [ 4791 ],
  190007. "attributes": {
  190008. "abc9_carry": "00000000000000000000000000000001",
  190009. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190010. }
  190011. },
  190012. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2": {
  190013. "hide_name": 0,
  190014. "bits": [ 1254, 2384, 4793, 4794 ],
  190015. "attributes": {
  190016. "force_downto": "00000000000000000000000000000001",
  190017. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190018. }
  190019. },
  190020. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3": {
  190021. "hide_name": 0,
  190022. "bits": [ 2991, 4795 ],
  190023. "attributes": {
  190024. "force_downto": "00000000000000000000000000000001",
  190025. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190026. }
  190027. },
  190028. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  190029. "hide_name": 0,
  190030. "bits": [ 1246, 1247, 4797, 3700 ],
  190031. "attributes": {
  190032. "force_downto": "00000000000000000000000000000001",
  190033. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190034. }
  190035. },
  190036. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  190037. "hide_name": 0,
  190038. "bits": [ 2858, 2958, 2959 ],
  190039. "attributes": {
  190040. "force_downto": "00000000000000000000000000000001",
  190041. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190042. }
  190043. },
  190044. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190045. "hide_name": 0,
  190046. "bits": [ 1179, 1034, 4798 ],
  190047. "attributes": {
  190048. "force_downto": "00000000000000000000000000000001",
  190049. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190050. }
  190051. },
  190052. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190053. "hide_name": 0,
  190054. "bits": [ 1119, 1037, 1043, 4799 ],
  190055. "attributes": {
  190056. "force_downto": "00000000000000000000000000000001",
  190057. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190058. }
  190059. },
  190060. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_15_I3": {
  190061. "hide_name": 0,
  190062. "bits": [ 4794 ],
  190063. "attributes": {
  190064. "abc9_carry": "00000000000000000000000000000001",
  190065. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190066. }
  190067. },
  190068. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16_I2": {
  190069. "hide_name": 0,
  190070. "bits": [ 1254, 2470, 4802, 4803 ],
  190071. "attributes": {
  190072. "force_downto": "00000000000000000000000000000001",
  190073. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190074. }
  190075. },
  190076. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_16_I2_SB_LUT4_O_I2": {
  190077. "hide_name": 0,
  190078. "bits": [ 2535, 2536, 2537 ],
  190079. "attributes": {
  190080. "force_downto": "00000000000000000000000000000001",
  190081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190082. }
  190083. },
  190084. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2": {
  190085. "hide_name": 0,
  190086. "bits": [ 1254, 2474, 4805, 4806 ],
  190087. "attributes": {
  190088. "force_downto": "00000000000000000000000000000001",
  190089. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190090. }
  190091. },
  190092. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_17_I2_SB_LUT4_O_I1": {
  190093. "hide_name": 0,
  190094. "bits": [ 2581, 2582, 2583 ],
  190095. "attributes": {
  190096. "force_downto": "00000000000000000000000000000001",
  190097. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190098. }
  190099. },
  190100. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2": {
  190101. "hide_name": 0,
  190102. "bits": [ 1254, 2472, 4807, 4808 ],
  190103. "attributes": {
  190104. "force_downto": "00000000000000000000000000000001",
  190105. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190106. }
  190107. },
  190108. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_18_I2_SB_LUT4_O_I1": {
  190109. "hide_name": 0,
  190110. "bits": [ 2578, 2579, 2580 ],
  190111. "attributes": {
  190112. "force_downto": "00000000000000000000000000000001",
  190113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190114. }
  190115. },
  190116. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2": {
  190117. "hide_name": 0,
  190118. "bits": [ 1254, 2380, 3021, 3019 ],
  190119. "attributes": {
  190120. "force_downto": "00000000000000000000000000000001",
  190121. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190122. }
  190123. },
  190124. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_19_I2_SB_LUT4_O_I1": {
  190125. "hide_name": 0,
  190126. "bits": [ 2564, 2565, 2566 ],
  190127. "attributes": {
  190128. "force_downto": "00000000000000000000000000000001",
  190129. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190130. }
  190131. },
  190132. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I1": {
  190133. "hide_name": 0,
  190134. "bits": [ 2378, 2396, 2397 ],
  190135. "attributes": {
  190136. "force_downto": "00000000000000000000000000000001",
  190137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190138. }
  190139. },
  190140. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I2": {
  190141. "hide_name": 0,
  190142. "bits": [ 1254, 2397, 4762, 4763 ],
  190143. "attributes": {
  190144. "force_downto": "00000000000000000000000000000001",
  190145. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190146. }
  190147. },
  190148. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_1_I3": {
  190149. "hide_name": 0,
  190150. "bits": [ 4763 ],
  190151. "attributes": {
  190152. "abc9_carry": "00000000000000000000000000000001",
  190153. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  190154. }
  190155. },
  190156. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_21_I1": {
  190157. "hide_name": 0,
  190158. "bits": [ 2378, 2384, 2385 ],
  190159. "attributes": {
  190160. "force_downto": "00000000000000000000000000000001",
  190161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190162. }
  190163. },
  190164. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_23_I1": {
  190165. "hide_name": 0,
  190166. "bits": [ 2378, 2392, 2393 ],
  190167. "attributes": {
  190168. "force_downto": "00000000000000000000000000000001",
  190169. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190170. }
  190171. },
  190172. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3": {
  190173. "hide_name": 0,
  190174. "bits": [ 1254, 2469, 4811 ],
  190175. "attributes": {
  190176. "force_downto": "00000000000000000000000000000001",
  190177. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190178. }
  190179. },
  190180. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O": {
  190181. "hide_name": 0,
  190182. "bits": [ 1246, 1247, 4813, 4812 ],
  190183. "attributes": {
  190184. "force_downto": "00000000000000000000000000000001",
  190185. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190186. }
  190187. },
  190188. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  190189. "hide_name": 0,
  190190. "bits": [ 2858, 2967, 2968 ],
  190191. "attributes": {
  190192. "force_downto": "00000000000000000000000000000001",
  190193. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190194. }
  190195. },
  190196. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190197. "hide_name": 0,
  190198. "bits": [ 1155, 1034, 4814 ],
  190199. "attributes": {
  190200. "force_downto": "00000000000000000000000000000001",
  190201. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190202. }
  190203. },
  190204. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190205. "hide_name": 0,
  190206. "bits": [ 1066, 1037, 1043, 4815 ],
  190207. "attributes": {
  190208. "force_downto": "00000000000000000000000000000001",
  190209. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190210. }
  190211. },
  190212. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  190213. "hide_name": 0,
  190214. "bits": [ 2991, 4816 ],
  190215. "attributes": {
  190216. "force_downto": "00000000000000000000000000000001",
  190217. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190218. }
  190219. },
  190220. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3": {
  190221. "hide_name": 0,
  190222. "bits": [ 2991, 4817 ],
  190223. "attributes": {
  190224. "force_downto": "00000000000000000000000000000001",
  190225. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190226. }
  190227. },
  190228. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O": {
  190229. "hide_name": 0,
  190230. "bits": [ 1246, 1247, 4819, 3696 ],
  190231. "attributes": {
  190232. "force_downto": "00000000000000000000000000000001",
  190233. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190234. }
  190235. },
  190236. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  190237. "hide_name": 0,
  190238. "bits": [ 2858, 3062, 3063 ],
  190239. "attributes": {
  190240. "force_downto": "00000000000000000000000000000001",
  190241. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190242. }
  190243. },
  190244. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190245. "hide_name": 0,
  190246. "bits": [ 1168, 1034, 4820 ],
  190247. "attributes": {
  190248. "force_downto": "00000000000000000000000000000001",
  190249. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190250. }
  190251. },
  190252. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190253. "hide_name": 0,
  190254. "bits": [ 1094, 1037, 1043, 4821 ],
  190255. "attributes": {
  190256. "force_downto": "00000000000000000000000000000001",
  190257. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190258. }
  190259. },
  190260. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_I3_O": {
  190261. "hide_name": 0,
  190262. "bits": [ 1254, 2395, 4760, 4761 ],
  190263. "attributes": {
  190264. "force_downto": "00000000000000000000000000000001",
  190265. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190266. }
  190267. },
  190268. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_I2_I3_SB_LUT4_O_I3": {
  190269. "hide_name": 0,
  190270. "bits": [ 4258, 2868, 4822 ],
  190271. "attributes": {
  190272. "force_downto": "00000000000000000000000000000001",
  190273. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190274. }
  190275. },
  190276. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190277. "hide_name": 0,
  190278. "bits": [ 4250, 2868, 4823 ],
  190279. "attributes": {
  190280. "force_downto": "00000000000000000000000000000001",
  190281. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190282. }
  190283. },
  190284. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I2": {
  190285. "hide_name": 0,
  190286. "bits": [ "0", 2469, 4824, 4825 ],
  190287. "attributes": {
  190288. "force_downto": "00000000000000000000000000000001",
  190289. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190290. }
  190291. },
  190292. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3": {
  190293. "hide_name": 0,
  190294. "bits": [ 4825 ],
  190295. "attributes": {
  190296. "abc9_carry": "00000000000000000000000000000001",
  190297. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190298. }
  190299. },
  190300. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO": {
  190301. "hide_name": 0,
  190302. "bits": [ 4826 ],
  190303. "attributes": {
  190304. "abc9_carry": "00000000000000000000000000000001",
  190305. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190306. }
  190307. },
  190308. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  190309. "hide_name": 0,
  190310. "bits": [ 1254, 1251, 4281, 1255 ],
  190311. "attributes": {
  190312. "force_downto": "00000000000000000000000000000001",
  190313. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190314. }
  190315. },
  190316. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  190317. "hide_name": 0,
  190318. "bits": [ 4827 ],
  190319. "attributes": {
  190320. "abc9_carry": "00000000000000000000000000000001",
  190321. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190322. }
  190323. },
  190324. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1": {
  190325. "hide_name": 0,
  190326. "bits": [ "0", 2473, 4828, 4827 ],
  190327. "attributes": {
  190328. "force_downto": "00000000000000000000000000000001",
  190329. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190330. }
  190331. },
  190332. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O": {
  190333. "hide_name": 0,
  190334. "bits": [ 1254, 1242, 2473, 4829 ],
  190335. "attributes": {
  190336. "force_downto": "00000000000000000000000000000001",
  190337. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190338. }
  190339. },
  190340. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O": {
  190341. "hide_name": 0,
  190342. "bits": [ 2858, 2977, 2978, 2979 ],
  190343. "attributes": {
  190344. "force_downto": "00000000000000000000000000000001",
  190345. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190346. }
  190347. },
  190348. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3": {
  190349. "hide_name": 0,
  190350. "bits": [ 1166, 1034, 4831 ],
  190351. "attributes": {
  190352. "force_downto": "00000000000000000000000000000001",
  190353. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190354. }
  190355. },
  190356. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_I2_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  190357. "hide_name": 0,
  190358. "bits": [ 1088, 1037, 1043, 4832 ],
  190359. "attributes": {
  190360. "force_downto": "00000000000000000000000000000001",
  190361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190362. }
  190363. },
  190364. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3": {
  190365. "hide_name": 0,
  190366. "bits": [ 2991, 3073 ],
  190367. "attributes": {
  190368. "force_downto": "00000000000000000000000000000001",
  190369. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190370. }
  190371. },
  190372. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  190373. "hide_name": 0,
  190374. "bits": [ 1246, 1247, 4830 ],
  190375. "attributes": {
  190376. "force_downto": "00000000000000000000000000000001",
  190377. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190378. }
  190379. },
  190380. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_24_I3_SB_LUT4_O_I3_SB_CARRY_CO_I1_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190381. "hide_name": 0,
  190382. "bits": [ 4257, 2868, 4833 ],
  190383. "attributes": {
  190384. "force_downto": "00000000000000000000000000000001",
  190385. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190386. }
  190387. },
  190388. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3": {
  190389. "hide_name": 0,
  190390. "bits": [ 1254, 2379, 4834 ],
  190391. "attributes": {
  190392. "force_downto": "00000000000000000000000000000001",
  190393. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190394. }
  190395. },
  190396. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O": {
  190397. "hide_name": 0,
  190398. "bits": [ 1246, 1247, 4836, 4835 ],
  190399. "attributes": {
  190400. "force_downto": "00000000000000000000000000000001",
  190401. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190402. }
  190403. },
  190404. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  190405. "hide_name": 0,
  190406. "bits": [ 2858, 2964, 2965 ],
  190407. "attributes": {
  190408. "force_downto": "00000000000000000000000000000001",
  190409. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190410. }
  190411. },
  190412. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190413. "hide_name": 0,
  190414. "bits": [ 1177, 1034, 4837 ],
  190415. "attributes": {
  190416. "force_downto": "00000000000000000000000000000001",
  190417. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190418. }
  190419. },
  190420. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190421. "hide_name": 0,
  190422. "bits": [ 1115, 1037, 1043, 4838 ],
  190423. "attributes": {
  190424. "force_downto": "00000000000000000000000000000001",
  190425. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190426. }
  190427. },
  190428. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  190429. "hide_name": 0,
  190430. "bits": [ 2991, 4839 ],
  190431. "attributes": {
  190432. "force_downto": "00000000000000000000000000000001",
  190433. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190434. }
  190435. },
  190436. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190437. "hide_name": 0,
  190438. "bits": [ 4262, 2868, 4841 ],
  190439. "attributes": {
  190440. "force_downto": "00000000000000000000000000000001",
  190441. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190442. }
  190443. },
  190444. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_O_I2": {
  190445. "hide_name": 0,
  190446. "bits": [ "0", 2379, 4842, 4843 ],
  190447. "attributes": {
  190448. "force_downto": "00000000000000000000000000000001",
  190449. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190450. }
  190451. },
  190452. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_25_I3_SB_LUT4_O_I3": {
  190453. "hide_name": 0,
  190454. "bits": [ 4843 ],
  190455. "attributes": {
  190456. "abc9_carry": "00000000000000000000000000000001",
  190457. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190458. }
  190459. },
  190460. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I2": {
  190461. "hide_name": 0,
  190462. "bits": [ 2378, 2382, 2383 ],
  190463. "attributes": {
  190464. "force_downto": "00000000000000000000000000000001",
  190465. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190466. }
  190467. },
  190468. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3": {
  190469. "hide_name": 0,
  190470. "bits": [ 1254, 2382, 4845 ],
  190471. "attributes": {
  190472. "force_downto": "00000000000000000000000000000001",
  190473. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190474. }
  190475. },
  190476. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O": {
  190477. "hide_name": 0,
  190478. "bits": [ 1246, 1247, 4847, 4846 ],
  190479. "attributes": {
  190480. "force_downto": "00000000000000000000000000000001",
  190481. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190482. }
  190483. },
  190484. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  190485. "hide_name": 0,
  190486. "bits": [ 2858, 2961, 2962 ],
  190487. "attributes": {
  190488. "force_downto": "00000000000000000000000000000001",
  190489. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190490. }
  190491. },
  190492. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190493. "hide_name": 0,
  190494. "bits": [ 1178, 1034, 4848 ],
  190495. "attributes": {
  190496. "force_downto": "00000000000000000000000000000001",
  190497. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190498. }
  190499. },
  190500. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190501. "hide_name": 0,
  190502. "bits": [ 1117, 1037, 1043, 4849 ],
  190503. "attributes": {
  190504. "force_downto": "00000000000000000000000000000001",
  190505. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190506. }
  190507. },
  190508. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  190509. "hide_name": 0,
  190510. "bits": [ 2991, 4850 ],
  190511. "attributes": {
  190512. "force_downto": "00000000000000000000000000000001",
  190513. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190514. }
  190515. },
  190516. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_I3_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190517. "hide_name": 0,
  190518. "bits": [ 4263, 2868, 4851 ],
  190519. "attributes": {
  190520. "force_downto": "00000000000000000000000000000001",
  190521. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190522. }
  190523. },
  190524. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_O_I2": {
  190525. "hide_name": 0,
  190526. "bits": [ "0", 2382, 4844, 4800 ],
  190527. "attributes": {
  190528. "force_downto": "00000000000000000000000000000001",
  190529. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190530. }
  190531. },
  190532. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_26_I3_SB_LUT4_O_I3": {
  190533. "hide_name": 0,
  190534. "bits": [ 4800 ],
  190535. "attributes": {
  190536. "abc9_carry": "00000000000000000000000000000001",
  190537. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190538. }
  190539. },
  190540. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3": {
  190541. "hide_name": 0,
  190542. "bits": [ 1254, 2386, 4852 ],
  190543. "attributes": {
  190544. "force_downto": "00000000000000000000000000000001",
  190545. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190546. }
  190547. },
  190548. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O": {
  190549. "hide_name": 0,
  190550. "bits": [ 1246, 1247, 4854, 4853 ],
  190551. "attributes": {
  190552. "force_downto": "00000000000000000000000000000001",
  190553. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190554. }
  190555. },
  190556. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  190557. "hide_name": 0,
  190558. "bits": [ 2858, 2955, 2956 ],
  190559. "attributes": {
  190560. "force_downto": "00000000000000000000000000000001",
  190561. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190562. }
  190563. },
  190564. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190565. "hide_name": 0,
  190566. "bits": [ 1180, 1034, 4855 ],
  190567. "attributes": {
  190568. "force_downto": "00000000000000000000000000000001",
  190569. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190570. }
  190571. },
  190572. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190573. "hide_name": 0,
  190574. "bits": [ 1121, 1037, 1043, 4856 ],
  190575. "attributes": {
  190576. "force_downto": "00000000000000000000000000000001",
  190577. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190578. }
  190579. },
  190580. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2": {
  190581. "hide_name": 0,
  190582. "bits": [ "0", 2386, 4801, 4792 ],
  190583. "attributes": {
  190584. "force_downto": "00000000000000000000000000000001",
  190585. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190586. }
  190587. },
  190588. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O_I3": {
  190589. "hide_name": 0,
  190590. "bits": [ 2991, 4857 ],
  190591. "attributes": {
  190592. "force_downto": "00000000000000000000000000000001",
  190593. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190594. }
  190595. },
  190596. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190597. "hide_name": 0,
  190598. "bits": [ 4265, 2868, 4858 ],
  190599. "attributes": {
  190600. "force_downto": "00000000000000000000000000000001",
  190601. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190602. }
  190603. },
  190604. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_27_I3_SB_LUT4_O_I3": {
  190605. "hide_name": 0,
  190606. "bits": [ 4792 ],
  190607. "attributes": {
  190608. "abc9_carry": "00000000000000000000000000000001",
  190609. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190610. }
  190611. },
  190612. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3": {
  190613. "hide_name": 0,
  190614. "bits": [ 966, 1250, 2781, 2782 ],
  190615. "attributes": {
  190616. "force_downto": "00000000000000000000000000000001",
  190617. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190618. }
  190619. },
  190620. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3": {
  190621. "hide_name": 0,
  190622. "bits": [ "0", 2991, 2467, 4804 ],
  190623. "attributes": {
  190624. "force_downto": "00000000000000000000000000000001",
  190625. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190626. }
  190627. },
  190628. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190629. "hide_name": 0,
  190630. "bits": [ 3639, 2536, 4859 ],
  190631. "attributes": {
  190632. "force_downto": "00000000000000000000000000000001",
  190633. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190634. }
  190635. },
  190636. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_28_I3_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  190637. "hide_name": 0,
  190638. "bits": [ 2372, 2466, 2532 ],
  190639. "attributes": {
  190640. "force_downto": "00000000000000000000000000000001",
  190641. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190642. }
  190643. },
  190644. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_2_I2": {
  190645. "hide_name": 0,
  190646. "bits": [ 1254, 2399, 4809, 4810 ],
  190647. "attributes": {
  190648. "force_downto": "00000000000000000000000000000001",
  190649. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190650. }
  190651. },
  190652. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_2_I3": {
  190653. "hide_name": 0,
  190654. "bits": [ 4810 ],
  190655. "attributes": {
  190656. "abc9_carry": "00000000000000000000000000000001",
  190657. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190658. }
  190659. },
  190660. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_3_I2": {
  190661. "hide_name": 0,
  190662. "bits": [ 1254, 2522, 4860, 4861 ],
  190663. "attributes": {
  190664. "force_downto": "00000000000000000000000000000001",
  190665. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190666. }
  190667. },
  190668. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_3_I3": {
  190669. "hide_name": 0,
  190670. "bits": [ 4861 ],
  190671. "attributes": {
  190672. "abc9_carry": "00000000000000000000000000000001",
  190673. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190674. }
  190675. },
  190676. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2": {
  190677. "hide_name": 0,
  190678. "bits": [ 1254, 2524, 4862, 4863 ],
  190679. "attributes": {
  190680. "force_downto": "00000000000000000000000000000001",
  190681. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190682. }
  190683. },
  190684. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3": {
  190685. "hide_name": 0,
  190686. "bits": [ 2991, 4864 ],
  190687. "attributes": {
  190688. "force_downto": "00000000000000000000000000000001",
  190689. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190690. }
  190691. },
  190692. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  190693. "hide_name": 0,
  190694. "bits": [ 1246, 1247, 4866, 3694 ],
  190695. "attributes": {
  190696. "force_downto": "00000000000000000000000000000001",
  190697. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190698. }
  190699. },
  190700. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  190701. "hide_name": 0,
  190702. "bits": [ 2858, 2883, 2884 ],
  190703. "attributes": {
  190704. "force_downto": "00000000000000000000000000000001",
  190705. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190706. }
  190707. },
  190708. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190709. "hide_name": 0,
  190710. "bits": [ 1164, 1034, 4867 ],
  190711. "attributes": {
  190712. "force_downto": "00000000000000000000000000000001",
  190713. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190714. }
  190715. },
  190716. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190717. "hide_name": 0,
  190718. "bits": [ 1084, 1037, 1043, 4868 ],
  190719. "attributes": {
  190720. "force_downto": "00000000000000000000000000000001",
  190721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190722. }
  190723. },
  190724. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190725. "hide_name": 0,
  190726. "bits": [ 4256, 2868, 4869 ],
  190727. "attributes": {
  190728. "force_downto": "00000000000000000000000000000001",
  190729. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190730. }
  190731. },
  190732. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_4_I3": {
  190733. "hide_name": 0,
  190734. "bits": [ 4863 ],
  190735. "attributes": {
  190736. "abc9_carry": "00000000000000000000000000000001",
  190737. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190738. }
  190739. },
  190740. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_5_I2": {
  190741. "hide_name": 0,
  190742. "bits": [ 1254, 2526, 4870, 4871 ],
  190743. "attributes": {
  190744. "force_downto": "00000000000000000000000000000001",
  190745. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190746. }
  190747. },
  190748. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_5_I3": {
  190749. "hide_name": 0,
  190750. "bits": [ 4871 ],
  190751. "attributes": {
  190752. "abc9_carry": "00000000000000000000000000000001",
  190753. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190754. }
  190755. },
  190756. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2": {
  190757. "hide_name": 0,
  190758. "bits": [ 1254, 2528, 4872, 4873 ],
  190759. "attributes": {
  190760. "force_downto": "00000000000000000000000000000001",
  190761. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190762. }
  190763. },
  190764. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3": {
  190765. "hide_name": 0,
  190766. "bits": [ 2991, 4874 ],
  190767. "attributes": {
  190768. "force_downto": "00000000000000000000000000000001",
  190769. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190770. }
  190771. },
  190772. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O": {
  190773. "hide_name": 0,
  190774. "bits": [ 1246, 1247, 4876, 3693 ],
  190775. "attributes": {
  190776. "force_downto": "00000000000000000000000000000001",
  190777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190778. }
  190779. },
  190780. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O": {
  190781. "hide_name": 0,
  190782. "bits": [ 2858, 2899, 2900 ],
  190783. "attributes": {
  190784. "force_downto": "00000000000000000000000000000001",
  190785. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190786. }
  190787. },
  190788. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190789. "hide_name": 0,
  190790. "bits": [ 1162, 1034, 4877 ],
  190791. "attributes": {
  190792. "force_downto": "00000000000000000000000000000001",
  190793. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190794. }
  190795. },
  190796. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_I3_1_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190797. "hide_name": 0,
  190798. "bits": [ 1080, 1037, 1043, 4878 ],
  190799. "attributes": {
  190800. "force_downto": "00000000000000000000000000000001",
  190801. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190802. }
  190803. },
  190804. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190805. "hide_name": 0,
  190806. "bits": [ 4255, 2868, 4879 ],
  190807. "attributes": {
  190808. "force_downto": "00000000000000000000000000000001",
  190809. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190810. }
  190811. },
  190812. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_6_I3": {
  190813. "hide_name": 0,
  190814. "bits": [ 4873 ],
  190815. "attributes": {
  190816. "abc9_carry": "00000000000000000000000000000001",
  190817. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190818. }
  190819. },
  190820. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I1": {
  190821. "hide_name": 0,
  190822. "bits": [ 2378, 2527, 2528 ],
  190823. "attributes": {
  190824. "force_downto": "00000000000000000000000000000001",
  190825. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190826. }
  190827. },
  190828. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I2": {
  190829. "hide_name": 0,
  190830. "bits": [ 1254, 2527, 4880, 4881 ],
  190831. "attributes": {
  190832. "force_downto": "00000000000000000000000000000001",
  190833. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190834. }
  190835. },
  190836. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_7_I3": {
  190837. "hide_name": 0,
  190838. "bits": [ 4881 ],
  190839. "attributes": {
  190840. "abc9_carry": "00000000000000000000000000000001",
  190841. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190842. }
  190843. },
  190844. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I1": {
  190845. "hide_name": 0,
  190846. "bits": [ 2378, 2525, 2526 ],
  190847. "attributes": {
  190848. "force_downto": "00000000000000000000000000000001",
  190849. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190850. }
  190851. },
  190852. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2": {
  190853. "hide_name": 0,
  190854. "bits": [ 1254, 2525, 4882, 4883 ],
  190855. "attributes": {
  190856. "force_downto": "00000000000000000000000000000001",
  190857. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190858. }
  190859. },
  190860. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3": {
  190861. "hide_name": 0,
  190862. "bits": [ 2991, 4884 ],
  190863. "attributes": {
  190864. "force_downto": "00000000000000000000000000000001",
  190865. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190866. }
  190867. },
  190868. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I1_O": {
  190869. "hide_name": 0,
  190870. "bits": [ 4294, 4295, 4296, 4297 ],
  190871. "attributes": {
  190872. "force_downto": "00000000000000000000000000000001",
  190873. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190874. }
  190875. },
  190876. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  190877. "hide_name": 0,
  190878. "bits": [ 1246, 1247, 4885, 3692 ],
  190879. "attributes": {
  190880. "force_downto": "00000000000000000000000000000001",
  190881. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190882. }
  190883. },
  190884. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  190885. "hide_name": 0,
  190886. "bits": [ 2858, 2914, 2915 ],
  190887. "attributes": {
  190888. "force_downto": "00000000000000000000000000000001",
  190889. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190890. }
  190891. },
  190892. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190893. "hide_name": 0,
  190894. "bits": [ 1160, 1034, 4886 ],
  190895. "attributes": {
  190896. "force_downto": "00000000000000000000000000000001",
  190897. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190898. }
  190899. },
  190900. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190901. "hide_name": 0,
  190902. "bits": [ 1076, 1037, 1043, 4887 ],
  190903. "attributes": {
  190904. "force_downto": "00000000000000000000000000000001",
  190905. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190906. }
  190907. },
  190908. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190909. "hide_name": 0,
  190910. "bits": [ 4254, 2868, 4888 ],
  190911. "attributes": {
  190912. "force_downto": "00000000000000000000000000000001",
  190913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190914. }
  190915. },
  190916. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_8_I3": {
  190917. "hide_name": 0,
  190918. "bits": [ 4883 ],
  190919. "attributes": {
  190920. "abc9_carry": "00000000000000000000000000000001",
  190921. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190922. }
  190923. },
  190924. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I1": {
  190925. "hide_name": 0,
  190926. "bits": [ 2378, 2523, 2524 ],
  190927. "attributes": {
  190928. "force_downto": "00000000000000000000000000000001",
  190929. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190930. }
  190931. },
  190932. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2": {
  190933. "hide_name": 0,
  190934. "bits": [ 1254, 2523, 4772, 4771 ],
  190935. "attributes": {
  190936. "force_downto": "00000000000000000000000000000001",
  190937. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190938. }
  190939. },
  190940. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3": {
  190941. "hide_name": 0,
  190942. "bits": [ 2991, 2894 ],
  190943. "attributes": {
  190944. "force_downto": "00000000000000000000000000000001",
  190945. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190946. }
  190947. },
  190948. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  190949. "hide_name": 0,
  190950. "bits": [ 1246, 1247, 4889, 3691 ],
  190951. "attributes": {
  190952. "force_downto": "00000000000000000000000000000001",
  190953. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190954. }
  190955. },
  190956. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  190957. "hide_name": 0,
  190958. "bits": [ 2858, 2917, 2918 ],
  190959. "attributes": {
  190960. "force_downto": "00000000000000000000000000000001",
  190961. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190962. }
  190963. },
  190964. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  190965. "hide_name": 0,
  190966. "bits": [ 1159, 1034, 4890 ],
  190967. "attributes": {
  190968. "force_downto": "00000000000000000000000000000001",
  190969. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190970. }
  190971. },
  190972. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190973. "hide_name": 0,
  190974. "bits": [ 1074, 1037, 1043, 4891 ],
  190975. "attributes": {
  190976. "force_downto": "00000000000000000000000000000001",
  190977. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190978. }
  190979. },
  190980. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I2_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  190981. "hide_name": 0,
  190982. "bits": [ 4253, 2868, 4892 ],
  190983. "attributes": {
  190984. "force_downto": "00000000000000000000000000000001",
  190985. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  190986. }
  190987. },
  190988. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_9_I3": {
  190989. "hide_name": 0,
  190990. "bits": [ 4771 ],
  190991. "attributes": {
  190992. "abc9_carry": "00000000000000000000000000000001",
  190993. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  190994. }
  190995. },
  190996. "cpu_I.execute_SrcPlugin_addSub_SB_LUT4_O_I1": {
  190997. "hide_name": 0,
  190998. "bits": [ 2378, 2394, 2395 ],
  190999. "attributes": {
  191000. "force_downto": "00000000000000000000000000000001",
  191001. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191002. }
  191003. },
  191004. "cpu_I.execute_arbitration_flushIt": {
  191005. "hide_name": 0,
  191006. "bits": [ "0" ],
  191007. "attributes": {
  191008. "hdlname": "cpu_I execute_arbitration_flushIt",
  191009. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:869.23-869.50"
  191010. }
  191011. },
  191012. "cpu_I.execute_arbitration_flushNext": {
  191013. "hide_name": 0,
  191014. "bits": [ 944 ],
  191015. "attributes": {
  191016. "hdlname": "cpu_I execute_arbitration_flushNext",
  191017. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:870.23-870.52"
  191018. }
  191019. },
  191020. "cpu_I.execute_arbitration_haltByOther": {
  191021. "hide_name": 0,
  191022. "bits": [ "0" ],
  191023. "attributes": {
  191024. "hdlname": "cpu_I execute_arbitration_haltByOther",
  191025. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:867.23-867.54"
  191026. }
  191027. },
  191028. "cpu_I.execute_arbitration_isStuck": {
  191029. "hide_name": 0,
  191030. "bits": [ 1020 ],
  191031. "attributes": {
  191032. "hdlname": "cpu_I execute_arbitration_isStuck",
  191033. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:872.23-872.50"
  191034. }
  191035. },
  191036. "cpu_I.execute_arbitration_isStuckByOthers": {
  191037. "hide_name": 0,
  191038. "bits": [ 1018 ],
  191039. "attributes": {
  191040. "hdlname": "cpu_I execute_arbitration_isStuckByOthers",
  191041. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:873.23-873.58"
  191042. }
  191043. },
  191044. "cpu_I.execute_to_memory_BRANCH_CALC": {
  191045. "hide_name": 0,
  191046. "bits": [ "0", "x", 1459, 1454, 1444, 1420, 1411, 1401, 1390, 1373, 1430, 1817, 1920, 1935, 1942, 1949, 1956, 1963, 1970, 1977, 1984, 1852, 1860, 1867, 1874, 1881, 1888, 1895, 1902, 1909, 1916, 1931 ],
  191047. "attributes": {
  191048. "hdlname": "cpu_I execute_to_memory_BRANCH_CALC",
  191049. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1293.23-1293.52"
  191050. }
  191051. },
  191052. "cpu_I.execute_to_memory_BRANCH_DO": {
  191053. "hide_name": 0,
  191054. "bits": [ 4893 ],
  191055. "attributes": {
  191056. "hdlname": "cpu_I execute_to_memory_BRANCH_DO",
  191057. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1299.23-1299.50"
  191058. }
  191059. },
  191060. "cpu_I.execute_to_memory_BRANCH_DO_SB_LUT4_I2_O": {
  191061. "hide_name": 0,
  191062. "bits": [ 1391, 1471, 1023 ],
  191063. "attributes": {
  191064. "force_downto": "00000000000000000000000000000001",
  191065. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191066. }
  191067. },
  191068. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE": {
  191069. "hide_name": 0,
  191070. "bits": [ 4894 ],
  191071. "attributes": {
  191072. "hdlname": "cpu_I execute_to_memory_BYPASSABLE_MEMORY_STAGE",
  191073. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1289.23-1289.64"
  191074. }
  191075. },
  191076. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_I3": {
  191077. "hide_name": 0,
  191078. "bits": [ 3280, 3281, 3970, 3971 ],
  191079. "attributes": {
  191080. "force_downto": "00000000000000000000000000000001",
  191081. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191082. }
  191083. },
  191084. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_I3_SB_LUT4_O_1_I2": {
  191085. "hide_name": 0,
  191086. "bits": [ 1552, 4896, 4897, 4898 ],
  191087. "attributes": {
  191088. "force_downto": "00000000000000000000000000000001",
  191089. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191090. }
  191091. },
  191092. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_1_O": {
  191093. "hide_name": 0,
  191094. "bits": [ 3848, 3153, 3972 ],
  191095. "attributes": {
  191096. "force_downto": "00000000000000000000000000000001",
  191097. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191098. }
  191099. },
  191100. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I0_O": {
  191101. "hide_name": 0,
  191102. "bits": [ 3715, 3179, 3973 ],
  191103. "attributes": {
  191104. "force_downto": "00000000000000000000000000000001",
  191105. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191106. }
  191107. },
  191108. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O": {
  191109. "hide_name": 0,
  191110. "bits": [ 3280, 3281, 3282, 3283 ],
  191111. "attributes": {
  191112. "force_downto": "00000000000000000000000000000001",
  191113. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191114. }
  191115. },
  191116. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O_1_I2": {
  191117. "hide_name": 0,
  191118. "bits": [ 1534, 4896, 4904, 4905 ],
  191119. "attributes": {
  191120. "force_downto": "00000000000000000000000000000001",
  191121. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191122. }
  191123. },
  191124. "cpu_I.execute_to_memory_BYPASSABLE_MEMORY_STAGE_SB_LUT4_I1_O_SB_LUT4_O_I2": {
  191125. "hide_name": 0,
  191126. "bits": [ 1535, 978, 4903, 4272 ],
  191127. "attributes": {
  191128. "force_downto": "00000000000000000000000000000001",
  191129. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191130. }
  191131. },
  191132. "cpu_I.execute_to_memory_ENV_CTRL": {
  191133. "hide_name": 0,
  191134. "bits": [ 4907, 4906 ],
  191135. "attributes": {
  191136. "hdlname": "cpu_I execute_to_memory_ENV_CTRL",
  191137. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1295.20-1295.46"
  191138. }
  191139. },
  191140. "cpu_I.execute_to_memory_INSTRUCTION": {
  191141. "hide_name": 0,
  191142. "bits": [ "x", "x", "x", "x", "x", 4913, "x", 4900, 4896, 4899, 4902, 4901, 3424, 2602, 3423, "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 4451, 4450, "x", "x" ],
  191143. "attributes": {
  191144. "hdlname": "cpu_I execute_to_memory_INSTRUCTION",
  191145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1267.23-1267.52"
  191146. }
  191147. },
  191148. "cpu_I.execute_to_memory_IS_DIV": {
  191149. "hide_name": 0,
  191150. "bits": [ 4908 ],
  191151. "attributes": {
  191152. "hdlname": "cpu_I execute_to_memory_IS_DIV",
  191153. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1277.23-1277.47"
  191154. }
  191155. },
  191156. "cpu_I.execute_to_memory_IS_DIV_SB_LUT4_I2_O": {
  191157. "hide_name": 0,
  191158. "bits": [ 5142, 3080 ],
  191159. "attributes": {
  191160. "force_downto": "00000000000000000000000000000001",
  191161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191162. }
  191163. },
  191164. "cpu_I.execute_to_memory_IS_MUL": {
  191165. "hide_name": 0,
  191166. "bits": [ 4909 ],
  191167. "attributes": {
  191168. "hdlname": "cpu_I execute_to_memory_IS_MUL",
  191169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1252.23-1252.47"
  191170. }
  191171. },
  191172. "cpu_I.execute_to_memory_MEMORY_ADDRESS_LOW": {
  191173. "hide_name": 0,
  191174. "bits": [ 4911, 4910 ],
  191175. "attributes": {
  191176. "hdlname": "cpu_I execute_to_memory_MEMORY_ADDRESS_LOW",
  191177. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1303.23-1303.59"
  191178. }
  191179. },
  191180. "cpu_I.execute_to_memory_MEMORY_ENABLE": {
  191181. "hide_name": 0,
  191182. "bits": [ 4912 ],
  191183. "attributes": {
  191184. "hdlname": "cpu_I execute_to_memory_MEMORY_ENABLE",
  191185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1249.23-1249.54"
  191186. }
  191187. },
  191188. "cpu_I.execute_to_memory_MEMORY_STORE": {
  191189. "hide_name": 0,
  191190. "bits": [ 4913 ],
  191191. "attributes": {
  191192. "hdlname": "cpu_I execute_to_memory_MEMORY_STORE",
  191193. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1246.23-1246.53"
  191194. }
  191195. },
  191196. "cpu_I.execute_to_memory_MEMORY_STORE_SB_LUT4_I0_I3": {
  191197. "hide_name": 0,
  191198. "bits": [ 4913, 4912, 3090, 4914 ],
  191199. "attributes": {
  191200. "force_downto": "00000000000000000000000000000001",
  191201. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191202. }
  191203. },
  191204. "cpu_I.execute_to_memory_MMU_FAULT": {
  191205. "hide_name": 0,
  191206. "bits": [ "0" ],
  191207. "attributes": {
  191208. "hdlname": "cpu_I execute_to_memory_MMU_FAULT",
  191209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1300.23-1300.50"
  191210. }
  191211. },
  191212. "cpu_I.execute_to_memory_MMU_RSP_refilling": {
  191213. "hide_name": 0,
  191214. "bits": [ "0" ],
  191215. "attributes": {
  191216. "hdlname": "cpu_I execute_to_memory_MMU_RSP_refilling",
  191217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1263.23-1263.58"
  191218. }
  191219. },
  191220. "cpu_I.execute_to_memory_MUL_HH": {
  191221. "hide_name": 0,
  191222. "bits": [ 4933, 4934, 4935, 4936, 4937, 4938, 4939, 4940, 4941, 4942, 4943, 4944, 4945, 4946, 4947, 4948, 4922, 4921, 4920, 4919, 4918, 4917, 4930, 4929, 4928, 4927, 4926, 4925, 4924, 4923, 4916, 4915, "x", "x" ],
  191223. "attributes": {
  191224. "hdlname": "cpu_I execute_to_memory_MUL_HH",
  191225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1241.23-1241.47"
  191226. }
  191227. },
  191228. "cpu_I.execute_to_memory_MUL_HH_SB_MAC16_O_ACCUMCO": {
  191229. "hide_name": 0,
  191230. "bits": [ 4931 ],
  191231. "attributes": {
  191232. "unused_bits": "0 "
  191233. }
  191234. },
  191235. "cpu_I.execute_to_memory_MUL_HH_SB_MAC16_O_CO": {
  191236. "hide_name": 0,
  191237. "bits": [ 4932 ],
  191238. "attributes": {
  191239. "unused_bits": "0 "
  191240. }
  191241. },
  191242. "cpu_I.execute_to_memory_MUL_HH_SB_MAC16_O_O": {
  191243. "hide_name": 0,
  191244. "bits": [ 4516, 4558, 4563, 4473, 4476, 4490, 4499, 4506, 4513, 4616, 4619, 4622, 4625, 4628, 4569, 4565 ],
  191245. "attributes": {
  191246. "force_downto": "00000000000000000000000000000001",
  191247. "src": "/usr/bin/../share/yosys/techmap.v:198.23-198.24"
  191248. }
  191249. },
  191250. "cpu_I.execute_to_memory_MUL_HH_SB_MAC16_O_SIGNEXTOUT": {
  191251. "hide_name": 0,
  191252. "bits": [ 4949 ],
  191253. "attributes": {
  191254. "unused_bits": "0 "
  191255. }
  191256. },
  191257. "cpu_I.execute_to_memory_MUL_HL": {
  191258. "hide_name": 0,
  191259. "bits": [ 4970, 4971, 4972, 4973, 4974, 4975, 4976, 4977, 4978, 4979, 4980, 4981, 4982, 4983, 4984, 4985, 4959, 4958, 4957, 4956, 4955, 4954, 4953, 4952, 4967, 4966, 4965, 4964, 4963, 4962, 4961, 4960, 4951, 4950 ],
  191260. "attributes": {
  191261. "hdlname": "cpu_I execute_to_memory_MUL_HL",
  191262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1278.23-1278.47"
  191263. }
  191264. },
  191265. "cpu_I.execute_to_memory_MUL_HL_SB_MAC16_O_ACCUMCO": {
  191266. "hide_name": 0,
  191267. "bits": [ 4968 ],
  191268. "attributes": {
  191269. "unused_bits": "0 "
  191270. }
  191271. },
  191272. "cpu_I.execute_to_memory_MUL_HL_SB_MAC16_O_CO": {
  191273. "hide_name": 0,
  191274. "bits": [ 4969 ],
  191275. "attributes": {
  191276. "unused_bits": "0 "
  191277. }
  191278. },
  191279. "cpu_I.execute_to_memory_MUL_HL_SB_MAC16_O_O": {
  191280. "hide_name": 0,
  191281. "bits": [ 4641, 4636, 4642, 4646, 4650, 4654, 4632, 4658, 4662, 4666, 4670, 4674, 4678, 4682, 4686, 4690, "0" ],
  191282. "attributes": {
  191283. "force_downto": "00000000000000000000000000000001",
  191284. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:31.22-31.23"
  191285. }
  191286. },
  191287. "cpu_I.execute_to_memory_MUL_HL_SB_MAC16_O_SIGNEXTOUT": {
  191288. "hide_name": 0,
  191289. "bits": [ 4986 ],
  191290. "attributes": {
  191291. "unused_bits": "0 "
  191292. }
  191293. },
  191294. "cpu_I.execute_to_memory_MUL_LH": {
  191295. "hide_name": 0,
  191296. "bits": [ 5006, 5007, 5008, 5009, 5010, 5011, 5012, 5013, 5014, 5015, 5016, 5017, 5018, 5019, 5020, 5021, 4995, 4994, 4993, 4992, 4991, 4990, 4989, 5003, 5002, 5001, 5000, 4999, 4998, 4997, 4996, 4988, 4987, 4987 ],
  191297. "attributes": {
  191298. "hdlname": "cpu_I execute_to_memory_MUL_LH",
  191299. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1308.23-1308.47"
  191300. }
  191301. },
  191302. "cpu_I.execute_to_memory_MUL_LH_SB_MAC16_O_ACCUMCO": {
  191303. "hide_name": 0,
  191304. "bits": [ 5004 ],
  191305. "attributes": {
  191306. "unused_bits": "0 "
  191307. }
  191308. },
  191309. "cpu_I.execute_to_memory_MUL_LH_SB_MAC16_O_CO": {
  191310. "hide_name": 0,
  191311. "bits": [ 5005 ],
  191312. "attributes": {
  191313. "unused_bits": "0 "
  191314. }
  191315. },
  191316. "cpu_I.execute_to_memory_MUL_LH_SB_MAC16_O_O": {
  191317. "hide_name": 0,
  191318. "bits": [ 4756, 4706, 4701, 4708, 4712, 4716, 4720, 4724, 4728, 4697, 4732, 4736, 4740, 4744, 4748, 4752, 7153 ],
  191319. "attributes": {
  191320. "force_downto": "00000000000000000000000000000001",
  191321. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:29.22-29.23",
  191322. "unused_bits": "16"
  191323. }
  191324. },
  191325. "cpu_I.execute_to_memory_MUL_LH_SB_MAC16_O_SIGNEXTOUT": {
  191326. "hide_name": 0,
  191327. "bits": [ 5022 ],
  191328. "attributes": {
  191329. "unused_bits": "0 "
  191330. }
  191331. },
  191332. "cpu_I.execute_to_memory_MUL_LL": {
  191333. "hide_name": 0,
  191334. "bits": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5041, 5042, 5043, 5044, 5045, 5046, 5047, 5048, 5049, 5050, 5051, 5052, 5053, 5054, 5055, 5056 ],
  191335. "attributes": {
  191336. "hdlname": "cpu_I execute_to_memory_MUL_LL",
  191337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1256.23-1256.47"
  191338. }
  191339. },
  191340. "cpu_I.execute_to_memory_MUL_LL_SB_MAC16_O_ACCUMCO": {
  191341. "hide_name": 0,
  191342. "bits": [ 5023 ],
  191343. "attributes": {
  191344. "unused_bits": "0 "
  191345. }
  191346. },
  191347. "cpu_I.execute_to_memory_MUL_LL_SB_MAC16_O_CO": {
  191348. "hide_name": 0,
  191349. "bits": [ 5024 ],
  191350. "attributes": {
  191351. "unused_bits": "0 "
  191352. }
  191353. },
  191354. "cpu_I.execute_to_memory_MUL_LL_SB_MAC16_O_SIGNEXTOUT": {
  191355. "hide_name": 0,
  191356. "bits": [ 5057 ],
  191357. "attributes": {
  191358. "unused_bits": "0 "
  191359. }
  191360. },
  191361. "cpu_I.execute_to_memory_PC": {
  191362. "hide_name": 0,
  191363. "bits": [ "0", "0", 5080, 5079, 5078, 5077, 5076, 5075, 5074, 5073, 5072, 5071, 5069, 5068, 5067, 5066, 5065, 5064, 5063, 5062, 5061, 5060, 5087, 5086, 5085, 5084, 5083, 5082, 5081, 5070, 5059, 5058 ],
  191364. "attributes": {
  191365. "hdlname": "cpu_I execute_to_memory_PC",
  191366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1283.23-1283.43"
  191367. }
  191368. },
  191369. "cpu_I.execute_to_memory_REGFILE_WRITE_DATA": {
  191370. "hide_name": 0,
  191371. "bits": [ 3180, 3235, 3197, 3274, 3158, 3227, 3242, 3247, 3185, 3252, 3240, 3257, 3262, 3267, 3272, 3089, 3100, 3105, 3112, 3119, 3126, 3223, 3133, 3216, 3140, 3147, 3154, 3168, 3209, 3204, 3190, 3173 ],
  191372. "attributes": {
  191373. "hdlname": "cpu_I execute_to_memory_REGFILE_WRITE_DATA",
  191374. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1290.23-1290.59"
  191375. }
  191376. },
  191377. "cpu_I.execute_to_memory_REGFILE_WRITE_VALID": {
  191378. "hide_name": 0,
  191379. "bits": [ 4895 ],
  191380. "attributes": {
  191381. "hdlname": "cpu_I execute_to_memory_REGFILE_WRITE_VALID",
  191382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1280.23-1280.60"
  191383. }
  191384. },
  191385. "cpu_I.execute_to_memory_SHIFT_CTRL": {
  191386. "hide_name": 0,
  191387. "bits": [ 3096, 3095 ],
  191388. "attributes": {
  191389. "hdlname": "cpu_I execute_to_memory_SHIFT_CTRL",
  191390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1274.20-1274.48"
  191391. }
  191392. },
  191393. "cpu_I.execute_to_memory_SHIFT_RIGHT": {
  191394. "hide_name": 0,
  191395. "bits": [ 3176, 3193, 3200, 3212, 3161, 3157, 3150, 3143, 3219, 3136, 3226, 3129, 3122, 3115, 3108, 3094, 3093, 3107, 3114, 3121, 3128, 3225, 3135, 3218, 3142, 3149, 3156, 3160, 3211, 3199, 3192, 3175 ],
  191396. "attributes": {
  191397. "hdlname": "cpu_I execute_to_memory_SHIFT_RIGHT",
  191398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1269.23-1269.52"
  191399. }
  191400. },
  191401. "cpu_I.externalInterrupt": {
  191402. "hide_name": 0,
  191403. "bits": [ "0" ],
  191404. "attributes": {
  191405. "hdlname": "cpu_I externalInterrupt",
  191406. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:952.23-952.40"
  191407. }
  191408. },
  191409. "cpu_I.externalInterruptArray": {
  191410. "hide_name": 0,
  191411. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  191412. "attributes": {
  191413. "hdlname": "cpu_I externalInterruptArray",
  191414. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:340.23-340.45"
  191415. }
  191416. },
  191417. "cpu_I.externalInterruptArray_regNext": {
  191418. "hide_name": 0,
  191419. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  191420. "attributes": {
  191421. "hdlname": "cpu_I externalInterruptArray_regNext",
  191422. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1238.23-1238.53"
  191423. }
  191424. },
  191425. "cpu_I.externalResetVector": {
  191426. "hide_name": 0,
  191427. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  191428. "attributes": {
  191429. "hdlname": "cpu_I externalResetVector",
  191430. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:337.23-337.42"
  191431. }
  191432. },
  191433. "cpu_I.iBusAXI_ar_payload_addr": {
  191434. "hide_name": 0,
  191435. "bits": [ "0", "0", "0", "0", "0", 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  191436. "attributes": {
  191437. "hdlname": "cpu_I iBusAXI_ar_payload_addr",
  191438. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:343.23-343.46"
  191439. }
  191440. },
  191441. "cpu_I.iBusAXI_ar_payload_burst": {
  191442. "hide_name": 0,
  191443. "bits": [ "1", "0" ],
  191444. "attributes": {
  191445. "hdlname": "cpu_I iBusAXI_ar_payload_burst",
  191446. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:345.23-345.47"
  191447. }
  191448. },
  191449. "cpu_I.iBusAXI_ar_payload_cache": {
  191450. "hide_name": 0,
  191451. "bits": [ "1", "1", "1", "1" ],
  191452. "attributes": {
  191453. "hdlname": "cpu_I iBusAXI_ar_payload_cache",
  191454. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:346.23-346.47"
  191455. }
  191456. },
  191457. "cpu_I.iBusAXI_ar_payload_len": {
  191458. "hide_name": 0,
  191459. "bits": [ "1", "1", "1", "0", "0", "0", "0", "0" ],
  191460. "attributes": {
  191461. "hdlname": "cpu_I iBusAXI_ar_payload_len",
  191462. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:344.23-344.45"
  191463. }
  191464. },
  191465. "cpu_I.iBusAXI_ar_payload_prot": {
  191466. "hide_name": 0,
  191467. "bits": [ "0", "1", "1" ],
  191468. "attributes": {
  191469. "hdlname": "cpu_I iBusAXI_ar_payload_prot",
  191470. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:347.23-347.46"
  191471. }
  191472. },
  191473. "cpu_I.iBusAXI_ar_valid": {
  191474. "hide_name": 0,
  191475. "bits": [ 738 ],
  191476. "attributes": {
  191477. "hdlname": "cpu_I iBusAXI_ar_valid",
  191478. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:341.23-341.39"
  191479. }
  191480. },
  191481. "cpu_I.iBusAXI_r_payload_data": {
  191482. "hide_name": 0,
  191483. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  191484. "attributes": {
  191485. "hdlname": "cpu_I iBusAXI_r_payload_data",
  191486. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:350.23-350.45"
  191487. }
  191488. },
  191489. "cpu_I.iBusAXI_r_payload_last": {
  191490. "hide_name": 0,
  191491. "bits": [ "0" ],
  191492. "attributes": {
  191493. "hdlname": "cpu_I iBusAXI_r_payload_last",
  191494. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:352.23-352.45"
  191495. }
  191496. },
  191497. "cpu_I.iBusAXI_r_payload_resp": {
  191498. "hide_name": 0,
  191499. "bits": [ "0", "0" ],
  191500. "attributes": {
  191501. "hdlname": "cpu_I iBusAXI_r_payload_resp",
  191502. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:351.23-351.45"
  191503. }
  191504. },
  191505. "cpu_I.iBusAXI_r_ready": {
  191506. "hide_name": 0,
  191507. "bits": [ "1" ],
  191508. "attributes": {
  191509. "hdlname": "cpu_I iBusAXI_r_ready",
  191510. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:349.23-349.38"
  191511. }
  191512. },
  191513. "cpu_I.iBusAXI_r_valid": {
  191514. "hide_name": 0,
  191515. "bits": [ 843 ],
  191516. "attributes": {
  191517. "hdlname": "cpu_I iBusAXI_r_valid",
  191518. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:348.23-348.38"
  191519. }
  191520. },
  191521. "cpu_I.iBus_cmd_payload_address": {
  191522. "hide_name": 0,
  191523. "bits": [ "0", "0", "0", "0", "0", 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  191524. "attributes": {
  191525. "hdlname": "cpu_I iBus_cmd_payload_address",
  191526. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1040.23-1040.47"
  191527. }
  191528. },
  191529. "cpu_I.iBus_cmd_payload_size": {
  191530. "hide_name": 0,
  191531. "bits": [ "1", "0", "1" ],
  191532. "attributes": {
  191533. "hdlname": "cpu_I iBus_cmd_payload_size",
  191534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1041.23-1041.44"
  191535. }
  191536. },
  191537. "cpu_I.iBus_cmd_valid": {
  191538. "hide_name": 0,
  191539. "bits": [ 738 ],
  191540. "attributes": {
  191541. "hdlname": "cpu_I iBus_cmd_valid",
  191542. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1038.23-1038.37"
  191543. }
  191544. },
  191545. "cpu_I.iBus_rsp_payload_data": {
  191546. "hide_name": 0,
  191547. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  191548. "attributes": {
  191549. "hdlname": "cpu_I iBus_rsp_payload_data",
  191550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1043.23-1043.44"
  191551. }
  191552. },
  191553. "cpu_I.iBus_rsp_payload_error": {
  191554. "hide_name": 0,
  191555. "bits": [ "0" ],
  191556. "attributes": {
  191557. "hdlname": "cpu_I iBus_rsp_payload_error",
  191558. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1044.23-1044.45"
  191559. }
  191560. },
  191561. "cpu_I.iBus_rsp_valid": {
  191562. "hide_name": 0,
  191563. "bits": [ 843 ],
  191564. "attributes": {
  191565. "hdlname": "cpu_I iBus_rsp_valid",
  191566. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1042.23-1042.37"
  191567. }
  191568. },
  191569. "cpu_I.lastStageInstruction": {
  191570. "hide_name": 0,
  191571. "bits": [ "x", "x", "x", "x", "x", "x", "x", 2268, 2267, 2266, 2265, 2264, 7154, 7155, 7100, "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 7156, 7157, "x", "x" ],
  191572. "attributes": {
  191573. "hdlname": "cpu_I lastStageInstruction",
  191574. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:899.23-899.43",
  191575. "unused_bits": "12 13 14 28 29"
  191576. }
  191577. },
  191578. "cpu_I.lastStagePc": {
  191579. "hide_name": 0,
  191580. "bits": [ "0", "0", 2841, 2805, 2827, 2829, 2831, 2833, 3976, 2836, 2838, 2840, 2786, 2788, 2790, 2792, 2794, 2796, 2798, 2800, 2802, 2804, 2808, 2810, 2812, 2814, 2816, 2818, 2820, 2822, 2824, 2826 ],
  191581. "attributes": {
  191582. "hdlname": "cpu_I lastStagePc",
  191583. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:900.23-900.34"
  191584. }
  191585. },
  191586. "cpu_I.lastStageRegFileWrite_payload_address": {
  191587. "hide_name": 0,
  191588. "bits": [ 2268, 2267, 2266, 2265, 2264, 2259 ],
  191589. "attributes": {
  191590. "hdlname": "cpu_I lastStageRegFileWrite_payload_address",
  191591. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1094.23-1094.60"
  191592. }
  191593. },
  191594. "cpu_I.lastStageRegFileWrite_payload_data": {
  191595. "hide_name": 0,
  191596. "bits": [ 2294, 2293, 2291, 2290, 2289, 2288, 2287, 2286, 2285, 2284, 2283, 2282, 2280, 2279, 2278, 2277, 2276, 2275, 2274, 2273, 2272, 2271, 2300, 2299, 2298, 2297, 2296, 2295, 2292, 2281, 2270, 2269 ],
  191597. "attributes": {
  191598. "hdlname": "cpu_I lastStageRegFileWrite_payload_data",
  191599. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1095.23-1095.57"
  191600. }
  191601. },
  191602. "cpu_I.memory_BRANCH_CALC": {
  191603. "hide_name": 0,
  191604. "bits": [ "0", "x", 1459, 1454, 1444, 1420, 1411, 1401, 1390, 1373, 1430, 1817, 1920, 1935, 1942, 1949, 1956, 1963, 1970, 1977, 1984, 1852, 1860, 1867, 1874, 1881, 1888, 1895, 1902, 1909, 1916, 1931 ],
  191605. "attributes": {
  191606. "hdlname": "cpu_I memory_BRANCH_CALC",
  191607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:757.23-757.41"
  191608. }
  191609. },
  191610. "cpu_I.memory_BRANCH_DO": {
  191611. "hide_name": 0,
  191612. "bits": [ 4893 ],
  191613. "attributes": {
  191614. "hdlname": "cpu_I memory_BRANCH_DO",
  191615. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:758.23-758.39"
  191616. }
  191617. },
  191618. "cpu_I.memory_BYPASSABLE_MEMORY_STAGE": {
  191619. "hide_name": 0,
  191620. "bits": [ 4894 ],
  191621. "attributes": {
  191622. "hdlname": "cpu_I memory_BYPASSABLE_MEMORY_STAGE",
  191623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:772.23-772.53"
  191624. }
  191625. },
  191626. "cpu_I.memory_DivPlugin_accumulator": {
  191627. "hide_name": 0,
  191628. "bits": [ 2719, 2667, 2684, 2689, 2694, 2699, 2704, 2709, 2717, 2652, 2711, 2721, 2726, 2731, 2736, 2741, 2746, 2749, 2601, 2610, 2615, 2620, 2625, 2630, 2635, 2640, 2645, 2650, 2662, 2674, 2679, 2751, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  191629. "attributes": {
  191630. "hdlname": "cpu_I memory_DivPlugin_accumulator",
  191631. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1218.23-1218.51"
  191632. }
  191633. },
  191634. "cpu_I.memory_DivPlugin_div_counter_valueNext": {
  191635. "hide_name": 0,
  191636. "bits": [ 5131, 5129, 5127, 5125, 5123, 5121 ],
  191637. "attributes": {
  191638. "hdlname": "cpu_I memory_DivPlugin_div_counter_valueNext",
  191639. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1223.23-1223.61"
  191640. }
  191641. },
  191642. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_1_I3": {
  191643. "hide_name": 0,
  191644. "bits": [ 5135 ],
  191645. "attributes": {
  191646. "abc9_carry": "00000000000000000000000000000001",
  191647. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191648. }
  191649. },
  191650. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_3_I0": {
  191651. "hide_name": 0,
  191652. "bits": [ 5134, "0", 5130, 5137 ],
  191653. "attributes": {
  191654. "force_downto": "00000000000000000000000000000001",
  191655. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191656. }
  191657. },
  191658. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_3_I3": {
  191659. "hide_name": 0,
  191660. "bits": [ 5137 ],
  191661. "attributes": {
  191662. "abc9_carry": "00000000000000000000000000000001",
  191663. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191664. }
  191665. },
  191666. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_4_I2": {
  191667. "hide_name": 0,
  191668. "bits": [ 5128, 5130, 5140 ],
  191669. "attributes": {
  191670. "force_downto": "00000000000000000000000000000001",
  191671. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191672. }
  191673. },
  191674. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_4_I3": {
  191675. "hide_name": 0,
  191676. "bits": [ 5139 ],
  191677. "attributes": {
  191678. "abc9_carry": "00000000000000000000000000000001",
  191679. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191680. }
  191681. },
  191682. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_5_I3": {
  191683. "hide_name": 0,
  191684. "bits": [ 5136 ],
  191685. "attributes": {
  191686. "abc9_carry": "00000000000000000000000000000001",
  191687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191688. }
  191689. },
  191690. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_I2": {
  191691. "hide_name": 0,
  191692. "bits": [ 5122, 5124, 5126 ],
  191693. "attributes": {
  191694. "force_downto": "00000000000000000000000000000001",
  191695. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191696. }
  191697. },
  191698. "cpu_I.memory_DivPlugin_div_counter_valueNext_SB_LUT4_O_I3": {
  191699. "hide_name": 0,
  191700. "bits": [ 5133 ],
  191701. "attributes": {
  191702. "abc9_carry": "00000000000000000000000000000001",
  191703. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4121.49-4121.94|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191704. }
  191705. },
  191706. "cpu_I.memory_DivPlugin_div_done": {
  191707. "hide_name": 0,
  191708. "bits": [ 5142 ],
  191709. "attributes": {
  191710. "hdlname": "cpu_I memory_DivPlugin_div_done",
  191711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1227.23-1227.48"
  191712. }
  191713. },
  191714. "cpu_I.memory_DivPlugin_div_done_SB_DFFSR_Q_D": {
  191715. "hide_name": 0,
  191716. "bits": [ 5141 ],
  191717. "attributes": {
  191718. }
  191719. },
  191720. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I1_I2": {
  191721. "hide_name": 0,
  191722. "bits": [ 5142, 5132, 5138 ],
  191723. "attributes": {
  191724. "force_downto": "00000000000000000000000000000001",
  191725. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191726. }
  191727. },
  191728. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I1_I2_SB_LUT4_I1_O": {
  191729. "hide_name": 0,
  191730. "bits": [ 5143 ],
  191731. "attributes": {
  191732. }
  191733. },
  191734. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I2_O": {
  191735. "hide_name": 0,
  191736. "bits": [ 4134, 4135 ],
  191737. "attributes": {
  191738. "force_downto": "00000000000000000000000000000001",
  191739. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191740. }
  191741. },
  191742. "cpu_I.memory_DivPlugin_div_done_SB_LUT4_I2_O_SB_LUT4_I2_O": {
  191743. "hide_name": 0,
  191744. "bits": [ 5089 ],
  191745. "attributes": {
  191746. }
  191747. },
  191748. "cpu_I.memory_DivPlugin_div_needRevert": {
  191749. "hide_name": 0,
  191750. "bits": [ 2604 ],
  191751. "attributes": {
  191752. "hdlname": "cpu_I memory_DivPlugin_div_needRevert",
  191753. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1220.23-1220.54"
  191754. }
  191755. },
  191756. "cpu_I.memory_DivPlugin_div_needRevert_SB_DFFE_Q_D": {
  191757. "hide_name": 0,
  191758. "bits": [ 5144 ],
  191759. "attributes": {
  191760. }
  191761. },
  191762. "cpu_I.memory_DivPlugin_div_needRevert_SB_DFFE_Q_D_SB_LUT4_O_I3": {
  191763. "hide_name": 0,
  191764. "bits": [ 964, 4150, 3987, 5145 ],
  191765. "attributes": {
  191766. "force_downto": "00000000000000000000000000000001",
  191767. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191768. }
  191769. },
  191770. "cpu_I.memory_DivPlugin_div_result": {
  191771. "hide_name": 0,
  191772. "bits": [ 3177, 3232, 3194, 3079, 3083, 3162, 3229, 3244, 3182, 3249, 3237, 3254, 3259, 3264, 3269, 3086, 3097, 3102, 3109, 3116, 3123, 3220, 3130, 3213, 3137, 3144, 3151, 3165, 3206, 3201, 3187, 3170 ],
  191773. "attributes": {
  191774. "hdlname": "cpu_I memory_DivPlugin_div_result",
  191775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1228.23-1228.50"
  191776. }
  191777. },
  191778. "cpu_I.memory_DivPlugin_div_stage_0_outNumerator": {
  191779. "hide_name": 0,
  191780. "bits": [ 7069, 2720, 2668, 2685, 2690, 2695, 2700, 2705, 2710, 2718, 2653, 2712, 2722, 2727, 2732, 2737, 2742, 2747, 2750, 2603, 2611, 2616, 2621, 2626, 2631, 2636, 2641, 2646, 2651, 2663, 2675, 2680 ],
  191781. "attributes": {
  191782. "hdlname": "cpu_I memory_DivPlugin_div_stage_0_outNumerator",
  191783. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1233.23-1233.64",
  191784. "unused_bits": "0 "
  191785. }
  191786. },
  191787. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder": {
  191788. "hide_name": 0,
  191789. "bits": [ 5114, 5113, 5111, 5110, 5109, 5108, 5107, 5106, 5105, 5104, 5103, 5102, 5100, 5099, 5098, 5097, 5096, 5095, 5094, 5093, 5092, 5091, 5120, 5119, 5118, 5117, 5116, 5115, 5112, 5101, 5090, 5088 ],
  191790. "attributes": {
  191791. "hdlname": "cpu_I memory_DivPlugin_div_stage_0_outRemainder",
  191792. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1232.23-1232.64"
  191793. }
  191794. },
  191795. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_10_I2": {
  191796. "hide_name": 0,
  191797. "bits": [ 4104, 2752, 5150, "1" ],
  191798. "attributes": {
  191799. "force_downto": "00000000000000000000000000000001",
  191800. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191801. }
  191802. },
  191803. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_11_I2": {
  191804. "hide_name": 0,
  191805. "bits": [ 4104, 2601, 5152, 5153 ],
  191806. "attributes": {
  191807. "force_downto": "00000000000000000000000000000001",
  191808. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191809. }
  191810. },
  191811. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_11_I3": {
  191812. "hide_name": 0,
  191813. "bits": [ 5153 ],
  191814. "attributes": {
  191815. "abc9_carry": "00000000000000000000000000000001",
  191816. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191817. }
  191818. },
  191819. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_12_I2": {
  191820. "hide_name": 0,
  191821. "bits": [ 4104, 2610, 5157, 5158 ],
  191822. "attributes": {
  191823. "force_downto": "00000000000000000000000000000001",
  191824. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191825. }
  191826. },
  191827. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_12_I3": {
  191828. "hide_name": 0,
  191829. "bits": [ 5158 ],
  191830. "attributes": {
  191831. "abc9_carry": "00000000000000000000000000000001",
  191832. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191833. }
  191834. },
  191835. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_13_I2": {
  191836. "hide_name": 0,
  191837. "bits": [ 4104, 2615, 5160, 5161 ],
  191838. "attributes": {
  191839. "force_downto": "00000000000000000000000000000001",
  191840. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191841. }
  191842. },
  191843. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_13_I3": {
  191844. "hide_name": 0,
  191845. "bits": [ 5161 ],
  191846. "attributes": {
  191847. "abc9_carry": "00000000000000000000000000000001",
  191848. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191849. }
  191850. },
  191851. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_14_I3": {
  191852. "hide_name": 0,
  191853. "bits": [ 5164 ],
  191854. "attributes": {
  191855. "abc9_carry": "00000000000000000000000000000001",
  191856. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191857. }
  191858. },
  191859. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_15_I2": {
  191860. "hide_name": 0,
  191861. "bits": [ 4104, 2625, 5165, 5166 ],
  191862. "attributes": {
  191863. "force_downto": "00000000000000000000000000000001",
  191864. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191865. }
  191866. },
  191867. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_15_I3": {
  191868. "hide_name": 0,
  191869. "bits": [ 5166 ],
  191870. "attributes": {
  191871. "abc9_carry": "00000000000000000000000000000001",
  191872. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191873. }
  191874. },
  191875. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_16_I2": {
  191876. "hide_name": 0,
  191877. "bits": [ 4104, 2630, 5168, 5169 ],
  191878. "attributes": {
  191879. "force_downto": "00000000000000000000000000000001",
  191880. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191881. }
  191882. },
  191883. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_16_I3": {
  191884. "hide_name": 0,
  191885. "bits": [ 5169 ],
  191886. "attributes": {
  191887. "abc9_carry": "00000000000000000000000000000001",
  191888. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191889. }
  191890. },
  191891. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_17_I2": {
  191892. "hide_name": 0,
  191893. "bits": [ 4104, 2635, 5171, 5172 ],
  191894. "attributes": {
  191895. "force_downto": "00000000000000000000000000000001",
  191896. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191897. }
  191898. },
  191899. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_17_I3": {
  191900. "hide_name": 0,
  191901. "bits": [ 5172 ],
  191902. "attributes": {
  191903. "abc9_carry": "00000000000000000000000000000001",
  191904. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191905. }
  191906. },
  191907. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_18_I2": {
  191908. "hide_name": 0,
  191909. "bits": [ 4104, 2640, 5174, 5175 ],
  191910. "attributes": {
  191911. "force_downto": "00000000000000000000000000000001",
  191912. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191913. }
  191914. },
  191915. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_18_I3": {
  191916. "hide_name": 0,
  191917. "bits": [ 5175 ],
  191918. "attributes": {
  191919. "abc9_carry": "00000000000000000000000000000001",
  191920. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191921. }
  191922. },
  191923. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_19_I2": {
  191924. "hide_name": 0,
  191925. "bits": [ 4104, 2645, 5177, 5178 ],
  191926. "attributes": {
  191927. "force_downto": "00000000000000000000000000000001",
  191928. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191929. }
  191930. },
  191931. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_19_I3": {
  191932. "hide_name": 0,
  191933. "bits": [ 5178 ],
  191934. "attributes": {
  191935. "abc9_carry": "00000000000000000000000000000001",
  191936. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191937. }
  191938. },
  191939. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_1_I2": {
  191940. "hide_name": 0,
  191941. "bits": [ 4104, 2652, 5148, 5149 ],
  191942. "attributes": {
  191943. "force_downto": "00000000000000000000000000000001",
  191944. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191945. }
  191946. },
  191947. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_1_I3": {
  191948. "hide_name": 0,
  191949. "bits": [ 5149 ],
  191950. "attributes": {
  191951. "abc9_carry": "00000000000000000000000000000001",
  191952. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191953. }
  191954. },
  191955. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_20_I2": {
  191956. "hide_name": 0,
  191957. "bits": [ 4104, 2650, 5183, 5184 ],
  191958. "attributes": {
  191959. "force_downto": "00000000000000000000000000000001",
  191960. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191961. }
  191962. },
  191963. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_20_I3": {
  191964. "hide_name": 0,
  191965. "bits": [ 5184 ],
  191966. "attributes": {
  191967. "abc9_carry": "00000000000000000000000000000001",
  191968. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191969. }
  191970. },
  191971. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_21_I2": {
  191972. "hide_name": 0,
  191973. "bits": [ 4104, 2719, 5186, 5187 ],
  191974. "attributes": {
  191975. "force_downto": "00000000000000000000000000000001",
  191976. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191977. }
  191978. },
  191979. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_21_I3": {
  191980. "hide_name": 0,
  191981. "bits": [ 5187 ],
  191982. "attributes": {
  191983. "abc9_carry": "00000000000000000000000000000001",
  191984. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  191985. }
  191986. },
  191987. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_22_I2": {
  191988. "hide_name": 0,
  191989. "bits": [ 4104, 2662, 5189, 5190 ],
  191990. "attributes": {
  191991. "force_downto": "00000000000000000000000000000001",
  191992. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  191993. }
  191994. },
  191995. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_22_I3": {
  191996. "hide_name": 0,
  191997. "bits": [ 5190 ],
  191998. "attributes": {
  191999. "abc9_carry": "00000000000000000000000000000001",
  192000. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192001. }
  192002. },
  192003. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_23_I2": {
  192004. "hide_name": 0,
  192005. "bits": [ 4104, 2674, 5192, 5193 ],
  192006. "attributes": {
  192007. "force_downto": "00000000000000000000000000000001",
  192008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192009. }
  192010. },
  192011. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_23_I3": {
  192012. "hide_name": 0,
  192013. "bits": [ 5193 ],
  192014. "attributes": {
  192015. "abc9_carry": "00000000000000000000000000000001",
  192016. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192017. }
  192018. },
  192019. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I2": {
  192020. "hide_name": 0,
  192021. "bits": [ 4104, 2679, 5195, 5196 ],
  192022. "attributes": {
  192023. "force_downto": "00000000000000000000000000000001",
  192024. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192025. }
  192026. },
  192027. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3": {
  192028. "hide_name": 0,
  192029. "bits": [ 5196 ],
  192030. "attributes": {
  192031. "abc9_carry": "00000000000000000000000000000001",
  192032. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192033. }
  192034. },
  192035. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3_SB_CARRY_CI_CO": {
  192036. "hide_name": 0,
  192037. "bits": [ 5198 ],
  192038. "attributes": {
  192039. "abc9_carry": "00000000000000000000000000000001",
  192040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192041. }
  192042. },
  192043. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_24_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  192044. "hide_name": 0,
  192045. "bits": [ 4104, 2620, 5163, 5164 ],
  192046. "attributes": {
  192047. "force_downto": "00000000000000000000000000000001",
  192048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192049. }
  192050. },
  192051. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_25_I2": {
  192052. "hide_name": 0,
  192053. "bits": [ 4104, 2667, 5200, 5201 ],
  192054. "attributes": {
  192055. "force_downto": "00000000000000000000000000000001",
  192056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192057. }
  192058. },
  192059. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_25_I3": {
  192060. "hide_name": 0,
  192061. "bits": [ 5201 ],
  192062. "attributes": {
  192063. "abc9_carry": "00000000000000000000000000000001",
  192064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192065. }
  192066. },
  192067. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_26_I2": {
  192068. "hide_name": 0,
  192069. "bits": [ 4104, 2684, 5203, 5204 ],
  192070. "attributes": {
  192071. "force_downto": "00000000000000000000000000000001",
  192072. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192073. }
  192074. },
  192075. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_26_I3": {
  192076. "hide_name": 0,
  192077. "bits": [ 5204 ],
  192078. "attributes": {
  192079. "abc9_carry": "00000000000000000000000000000001",
  192080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192081. }
  192082. },
  192083. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_27_I2": {
  192084. "hide_name": 0,
  192085. "bits": [ 4104, 2689, 5206, 5207 ],
  192086. "attributes": {
  192087. "force_downto": "00000000000000000000000000000001",
  192088. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192089. }
  192090. },
  192091. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_27_I3": {
  192092. "hide_name": 0,
  192093. "bits": [ 5207 ],
  192094. "attributes": {
  192095. "abc9_carry": "00000000000000000000000000000001",
  192096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192097. }
  192098. },
  192099. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_28_I2": {
  192100. "hide_name": 0,
  192101. "bits": [ 4104, 2694, 5209, 5210 ],
  192102. "attributes": {
  192103. "force_downto": "00000000000000000000000000000001",
  192104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192105. }
  192106. },
  192107. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_28_I3": {
  192108. "hide_name": 0,
  192109. "bits": [ 5210 ],
  192110. "attributes": {
  192111. "abc9_carry": "00000000000000000000000000000001",
  192112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192113. }
  192114. },
  192115. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_29_I2": {
  192116. "hide_name": 0,
  192117. "bits": [ 4104, 2699, 5212, 5213 ],
  192118. "attributes": {
  192119. "force_downto": "00000000000000000000000000000001",
  192120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192121. }
  192122. },
  192123. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_29_I3": {
  192124. "hide_name": 0,
  192125. "bits": [ 5213 ],
  192126. "attributes": {
  192127. "abc9_carry": "00000000000000000000000000000001",
  192128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192129. }
  192130. },
  192131. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_2_I2": {
  192132. "hide_name": 0,
  192133. "bits": [ 4104, 2711, 5181, 5182 ],
  192134. "attributes": {
  192135. "force_downto": "00000000000000000000000000000001",
  192136. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192137. }
  192138. },
  192139. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_2_I3": {
  192140. "hide_name": 0,
  192141. "bits": [ 5182 ],
  192142. "attributes": {
  192143. "abc9_carry": "00000000000000000000000000000001",
  192144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192145. }
  192146. },
  192147. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_30_I2": {
  192148. "hide_name": 0,
  192149. "bits": [ 4104, 2704, 5218, 5219 ],
  192150. "attributes": {
  192151. "force_downto": "00000000000000000000000000000001",
  192152. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192153. }
  192154. },
  192155. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_30_I3": {
  192156. "hide_name": 0,
  192157. "bits": [ 5219 ],
  192158. "attributes": {
  192159. "abc9_carry": "00000000000000000000000000000001",
  192160. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192161. }
  192162. },
  192163. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_31_I2": {
  192164. "hide_name": 0,
  192165. "bits": [ 4104, 2709, 5221, 5222 ],
  192166. "attributes": {
  192167. "force_downto": "00000000000000000000000000000001",
  192168. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192169. }
  192170. },
  192171. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_31_I3": {
  192172. "hide_name": 0,
  192173. "bits": [ 5222 ],
  192174. "attributes": {
  192175. "abc9_carry": "00000000000000000000000000000001",
  192176. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192177. }
  192178. },
  192179. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_3_I2": {
  192180. "hide_name": 0,
  192181. "bits": [ 4104, 2721, 5216, 5217 ],
  192182. "attributes": {
  192183. "force_downto": "00000000000000000000000000000001",
  192184. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192185. }
  192186. },
  192187. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_3_I3": {
  192188. "hide_name": 0,
  192189. "bits": [ 5217 ],
  192190. "attributes": {
  192191. "abc9_carry": "00000000000000000000000000000001",
  192192. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192193. }
  192194. },
  192195. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_4_I2": {
  192196. "hide_name": 0,
  192197. "bits": [ 4104, 2726, 5225, 5226 ],
  192198. "attributes": {
  192199. "force_downto": "00000000000000000000000000000001",
  192200. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192201. }
  192202. },
  192203. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_4_I3": {
  192204. "hide_name": 0,
  192205. "bits": [ 5226 ],
  192206. "attributes": {
  192207. "abc9_carry": "00000000000000000000000000000001",
  192208. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192209. }
  192210. },
  192211. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_5_I2": {
  192212. "hide_name": 0,
  192213. "bits": [ 4104, 2731, 5228, 5229 ],
  192214. "attributes": {
  192215. "force_downto": "00000000000000000000000000000001",
  192216. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192217. }
  192218. },
  192219. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_5_I3": {
  192220. "hide_name": 0,
  192221. "bits": [ 5229 ],
  192222. "attributes": {
  192223. "abc9_carry": "00000000000000000000000000000001",
  192224. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192225. }
  192226. },
  192227. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_6_I2": {
  192228. "hide_name": 0,
  192229. "bits": [ 4104, 2736, 5231, 5232 ],
  192230. "attributes": {
  192231. "force_downto": "00000000000000000000000000000001",
  192232. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192233. }
  192234. },
  192235. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_6_I3": {
  192236. "hide_name": 0,
  192237. "bits": [ 5232 ],
  192238. "attributes": {
  192239. "abc9_carry": "00000000000000000000000000000001",
  192240. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192241. }
  192242. },
  192243. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_7_I2": {
  192244. "hide_name": 0,
  192245. "bits": [ 4104, 2741, 5234, 5235 ],
  192246. "attributes": {
  192247. "force_downto": "00000000000000000000000000000001",
  192248. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192249. }
  192250. },
  192251. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_7_I3": {
  192252. "hide_name": 0,
  192253. "bits": [ 5235 ],
  192254. "attributes": {
  192255. "abc9_carry": "00000000000000000000000000000001",
  192256. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192257. }
  192258. },
  192259. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_8_I2": {
  192260. "hide_name": 0,
  192261. "bits": [ 4104, 2746, 5237, 5238 ],
  192262. "attributes": {
  192263. "force_downto": "00000000000000000000000000000001",
  192264. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192265. }
  192266. },
  192267. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_8_I3": {
  192268. "hide_name": 0,
  192269. "bits": [ 5238 ],
  192270. "attributes": {
  192271. "abc9_carry": "00000000000000000000000000000001",
  192272. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192273. }
  192274. },
  192275. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_9_I2": {
  192276. "hide_name": 0,
  192277. "bits": [ 4104, 2749, 5156, 5155 ],
  192278. "attributes": {
  192279. "force_downto": "00000000000000000000000000000001",
  192280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192281. }
  192282. },
  192283. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_9_I3": {
  192284. "hide_name": 0,
  192285. "bits": [ 5155 ],
  192286. "attributes": {
  192287. "abc9_carry": "00000000000000000000000000000001",
  192288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192289. }
  192290. },
  192291. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_I2": {
  192292. "hide_name": 0,
  192293. "bits": [ 4104, 2717, 5146, 5147 ],
  192294. "attributes": {
  192295. "force_downto": "00000000000000000000000000000001",
  192296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192297. }
  192298. },
  192299. "cpu_I.memory_DivPlugin_div_stage_0_outRemainder_SB_LUT4_O_I3": {
  192300. "hide_name": 0,
  192301. "bits": [ 5147 ],
  192302. "attributes": {
  192303. "abc9_carry": "00000000000000000000000000000001",
  192304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:4130.68-4130.124|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192305. }
  192306. },
  192307. "cpu_I.memory_DivPlugin_div_stage_0_remainderShifted": {
  192308. "hide_name": 0,
  192309. "bits": [ 2752, 2719, 2667, 2684, 2689, 2694, 2699, 2704, 2709, 2717, 2652, 2711, 2721, 2726, 2731, 2736, 2741, 2746, 2749, 2601, 2610, 2615, 2620, 2625, 2630, 2635, 2640, 2645, 2650, 2662, 2674, 2679, 2751 ],
  192310. "attributes": {
  192311. "hdlname": "cpu_I memory_DivPlugin_div_stage_0_remainderShifted",
  192312. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1230.23-1230.68"
  192313. }
  192314. },
  192315. "cpu_I.memory_DivPlugin_frontendOk": {
  192316. "hide_name": 0,
  192317. "bits": [ "1" ],
  192318. "attributes": {
  192319. "hdlname": "cpu_I memory_DivPlugin_frontendOk",
  192320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1219.23-1219.50"
  192321. }
  192322. },
  192323. "cpu_I.memory_DivPlugin_rs1": {
  192324. "hide_name": 0,
  192325. "bits": [ 2720, 2668, 2685, 2690, 2695, 2700, 2705, 2710, 2718, 2653, 2712, 2722, 2727, 2732, 2737, 2742, 2747, 2750, 2603, 2611, 2616, 2621, 2626, 2631, 2636, 2641, 2646, 2651, 2663, 2675, 2680, 2752, "x" ],
  192326. "attributes": {
  192327. "hdlname": "cpu_I memory_DivPlugin_rs1",
  192328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1216.23-1216.43"
  192329. }
  192330. },
  192331. "cpu_I.memory_DivPlugin_rs2": {
  192332. "hide_name": 0,
  192333. "bits": [ 5151, 5188, 5202, 5205, 5208, 5211, 5214, 5220, 5223, 5241, 5180, 5215, 5224, 5227, 5230, 5233, 5236, 5239, 5240, 5154, 5159, 5162, 5199, 5167, 5170, 5173, 5176, 5179, 5185, 5191, 5194, 5197 ],
  192334. "attributes": {
  192335. "hdlname": "cpu_I memory_DivPlugin_rs2",
  192336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1217.23-1217.43"
  192337. }
  192338. },
  192339. "cpu_I.memory_ENV_CTRL": {
  192340. "hide_name": 0,
  192341. "bits": [ 4907, 4906 ],
  192342. "attributes": {
  192343. "hdlname": "cpu_I memory_ENV_CTRL",
  192344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:751.20-751.35"
  192345. }
  192346. },
  192347. "cpu_I.memory_INSTRUCTION": {
  192348. "hide_name": 0,
  192349. "bits": [ "x", "x", "x", "x", "x", 4913, "x", 4900, 4896, 4899, 4902, 4901, 3424, 2602, 3423, "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 4451, 4450, "x", "x" ],
  192350. "attributes": {
  192351. "hdlname": "cpu_I memory_INSTRUCTION",
  192352. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:771.23-771.41"
  192353. }
  192354. },
  192355. "cpu_I.memory_IS_DIV": {
  192356. "hide_name": 0,
  192357. "bits": [ 4908 ],
  192358. "attributes": {
  192359. "hdlname": "cpu_I memory_IS_DIV",
  192360. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:741.23-741.36"
  192361. }
  192362. },
  192363. "cpu_I.memory_IS_MUL": {
  192364. "hide_name": 0,
  192365. "bits": [ 4909 ],
  192366. "attributes": {
  192367. "hdlname": "cpu_I memory_IS_MUL",
  192368. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:731.23-731.36"
  192369. }
  192370. },
  192371. "cpu_I.memory_MEMORY_ADDRESS_LOW": {
  192372. "hide_name": 0,
  192373. "bits": [ 4911, 4910 ],
  192374. "attributes": {
  192375. "hdlname": "cpu_I memory_MEMORY_ADDRESS_LOW",
  192376. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:680.23-680.48"
  192377. }
  192378. },
  192379. "cpu_I.memory_MEMORY_ENABLE": {
  192380. "hide_name": 0,
  192381. "bits": [ 4912 ],
  192382. "attributes": {
  192383. "hdlname": "cpu_I memory_MEMORY_ENABLE",
  192384. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:828.23-828.43"
  192385. }
  192386. },
  192387. "cpu_I.memory_MEMORY_READ_DATA": {
  192388. "hide_name": 0,
  192389. "bits": [ 822, 786, 840, 831, 828, 825, 816, 783, 750, 747, 819, 813, 810, 807, 804, 801, 798, 795, 792, 789, 780, 777, 774, 771, 768, 765, 762, 759, 756, 753, 837, 834 ],
  192390. "attributes": {
  192391. "hdlname": "cpu_I memory_MEMORY_READ_DATA",
  192392. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:672.23-672.46"
  192393. }
  192394. },
  192395. "cpu_I.memory_MEMORY_STORE": {
  192396. "hide_name": 0,
  192397. "bits": [ 4913 ],
  192398. "attributes": {
  192399. "hdlname": "cpu_I memory_MEMORY_STORE",
  192400. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:827.23-827.42"
  192401. }
  192402. },
  192403. "cpu_I.memory_MMU_FAULT": {
  192404. "hide_name": 0,
  192405. "bits": [ "0" ],
  192406. "attributes": {
  192407. "hdlname": "cpu_I memory_MMU_FAULT",
  192408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:817.23-817.39"
  192409. }
  192410. },
  192411. "cpu_I.memory_MMU_RSP_refilling": {
  192412. "hide_name": 0,
  192413. "bits": [ "0" ],
  192414. "attributes": {
  192415. "hdlname": "cpu_I memory_MMU_RSP_refilling",
  192416. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:824.23-824.47"
  192417. }
  192418. },
  192419. "cpu_I.memory_MUL_HH": {
  192420. "hide_name": 0,
  192421. "bits": [ 4933, 4934, 4935, 4936, 4937, 4938, 4939, 4940, 4941, 4942, 4943, 4944, 4945, 4946, 4947, 4948, 4922, 4921, 4920, 4919, 4918, 4917, 4930, 4929, 4928, 4927, 4926, 4925, 4924, 4923, 4916, 4915, "x", "x" ],
  192422. "attributes": {
  192423. "hdlname": "cpu_I memory_MUL_HH",
  192424. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:736.23-736.36"
  192425. }
  192426. },
  192427. "cpu_I.memory_MUL_HL": {
  192428. "hide_name": 0,
  192429. "bits": [ 4970, 4971, 4972, 4973, 4974, 4975, 4976, 4977, 4978, 4979, 4980, 4981, 4982, 4983, 4984, 4985, 4959, 4958, 4957, 4956, 4955, 4954, 4953, 4952, 4967, 4966, 4965, 4964, 4963, 4962, 4961, 4960, 4951, 4950 ],
  192430. "attributes": {
  192431. "hdlname": "cpu_I memory_MUL_HL",
  192432. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:745.23-745.36"
  192433. }
  192434. },
  192435. "cpu_I.memory_MUL_LH": {
  192436. "hide_name": 0,
  192437. "bits": [ 5006, 5007, 5008, 5009, 5010, 5011, 5012, 5013, 5014, 5015, 5016, 5017, 5018, 5019, 5020, 5021, 4995, 4994, 4993, 4992, 4991, 4990, 4989, 5003, 5002, 5001, 5000, 4999, 4998, 4997, 4996, 4988, 4987, 4987 ],
  192438. "attributes": {
  192439. "hdlname": "cpu_I memory_MUL_LH",
  192440. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:746.23-746.36"
  192441. }
  192442. },
  192443. "cpu_I.memory_MUL_LL": {
  192444. "hide_name": 0,
  192445. "bits": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5041, 5042, 5043, 5044, 5045, 5046, 5047, 5048, 5049, 5050, 5051, 5052, 5053, 5054, 5055, 5056 ],
  192446. "attributes": {
  192447. "hdlname": "cpu_I memory_MUL_LL",
  192448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:747.23-747.36"
  192449. }
  192450. },
  192451. "cpu_I.memory_MUL_LOW": {
  192452. "hide_name": 0,
  192453. "bits": [ 5025, 5026, 5027, 5028, 5029, 5030, 5031, 5032, 5033, 5034, 5035, 5036, 5037, 5038, 5039, 5040, 5354, 5296, 5340, 5358, 5362, 5366, 5370, 5374, 5375, 5252, 5259, 5263, 5267, 5271, 5275, 5279, 5283, 5287, 5245, 5291, 5300, 5304, 5308, 5312, 5316, 5320, 5324, 5328, 5332, 5336, 5344, 5348, 5352, 5353, 5248, 5248 ],
  192454. "attributes": {
  192455. "hdlname": "cpu_I memory_MUL_LOW",
  192456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:687.23-687.37"
  192457. }
  192458. },
  192459. "cpu_I.memory_MUL_LOW_SB_LUT4_O_10_I1": {
  192460. "hide_name": 0,
  192461. "bits": [ "0", 5249, 5250, 5251 ],
  192462. "attributes": {
  192463. "force_downto": "00000000000000000000000000000001",
  192464. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192465. }
  192466. },
  192467. "cpu_I.memory_MUL_LOW_SB_LUT4_O_10_I3": {
  192468. "hide_name": 0,
  192469. "bits": [ 5251 ],
  192470. "attributes": {
  192471. "abc9_carry": "00000000000000000000000000000001",
  192472. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192473. }
  192474. },
  192475. "cpu_I.memory_MUL_LOW_SB_LUT4_O_11_I1": {
  192476. "hide_name": 0,
  192477. "bits": [ "0", 5256, 5257, 5258 ],
  192478. "attributes": {
  192479. "force_downto": "00000000000000000000000000000001",
  192480. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192481. }
  192482. },
  192483. "cpu_I.memory_MUL_LOW_SB_LUT4_O_11_I3": {
  192484. "hide_name": 0,
  192485. "bits": [ 5258 ],
  192486. "attributes": {
  192487. "abc9_carry": "00000000000000000000000000000001",
  192488. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192489. }
  192490. },
  192491. "cpu_I.memory_MUL_LOW_SB_LUT4_O_12_I1": {
  192492. "hide_name": 0,
  192493. "bits": [ "0", 5260, 5261, 5262 ],
  192494. "attributes": {
  192495. "force_downto": "00000000000000000000000000000001",
  192496. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192497. }
  192498. },
  192499. "cpu_I.memory_MUL_LOW_SB_LUT4_O_12_I3": {
  192500. "hide_name": 0,
  192501. "bits": [ 5262 ],
  192502. "attributes": {
  192503. "abc9_carry": "00000000000000000000000000000001",
  192504. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192505. }
  192506. },
  192507. "cpu_I.memory_MUL_LOW_SB_LUT4_O_13_I1": {
  192508. "hide_name": 0,
  192509. "bits": [ "0", 5264, 5265, 5266 ],
  192510. "attributes": {
  192511. "force_downto": "00000000000000000000000000000001",
  192512. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192513. }
  192514. },
  192515. "cpu_I.memory_MUL_LOW_SB_LUT4_O_13_I3": {
  192516. "hide_name": 0,
  192517. "bits": [ 5266 ],
  192518. "attributes": {
  192519. "abc9_carry": "00000000000000000000000000000001",
  192520. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192521. }
  192522. },
  192523. "cpu_I.memory_MUL_LOW_SB_LUT4_O_14_I1": {
  192524. "hide_name": 0,
  192525. "bits": [ "0", 5268, 5269, 5270 ],
  192526. "attributes": {
  192527. "force_downto": "00000000000000000000000000000001",
  192528. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192529. }
  192530. },
  192531. "cpu_I.memory_MUL_LOW_SB_LUT4_O_14_I3": {
  192532. "hide_name": 0,
  192533. "bits": [ 5270 ],
  192534. "attributes": {
  192535. "abc9_carry": "00000000000000000000000000000001",
  192536. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192537. }
  192538. },
  192539. "cpu_I.memory_MUL_LOW_SB_LUT4_O_15_I1": {
  192540. "hide_name": 0,
  192541. "bits": [ "0", 5272, 5273, 5274 ],
  192542. "attributes": {
  192543. "force_downto": "00000000000000000000000000000001",
  192544. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192545. }
  192546. },
  192547. "cpu_I.memory_MUL_LOW_SB_LUT4_O_15_I3": {
  192548. "hide_name": 0,
  192549. "bits": [ 5274 ],
  192550. "attributes": {
  192551. "abc9_carry": "00000000000000000000000000000001",
  192552. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192553. }
  192554. },
  192555. "cpu_I.memory_MUL_LOW_SB_LUT4_O_16_I1": {
  192556. "hide_name": 0,
  192557. "bits": [ "0", 5276, 5277, 5278 ],
  192558. "attributes": {
  192559. "force_downto": "00000000000000000000000000000001",
  192560. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192561. }
  192562. },
  192563. "cpu_I.memory_MUL_LOW_SB_LUT4_O_16_I3": {
  192564. "hide_name": 0,
  192565. "bits": [ 5278 ],
  192566. "attributes": {
  192567. "abc9_carry": "00000000000000000000000000000001",
  192568. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192569. }
  192570. },
  192571. "cpu_I.memory_MUL_LOW_SB_LUT4_O_17_I1": {
  192572. "hide_name": 0,
  192573. "bits": [ "0", 5280, 5281, 5282 ],
  192574. "attributes": {
  192575. "force_downto": "00000000000000000000000000000001",
  192576. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192577. }
  192578. },
  192579. "cpu_I.memory_MUL_LOW_SB_LUT4_O_17_I3": {
  192580. "hide_name": 0,
  192581. "bits": [ 5282 ],
  192582. "attributes": {
  192583. "abc9_carry": "00000000000000000000000000000001",
  192584. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192585. }
  192586. },
  192587. "cpu_I.memory_MUL_LOW_SB_LUT4_O_18_I1": {
  192588. "hide_name": 0,
  192589. "bits": [ "0", 5284, 5285, 5286 ],
  192590. "attributes": {
  192591. "force_downto": "00000000000000000000000000000001",
  192592. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192593. }
  192594. },
  192595. "cpu_I.memory_MUL_LOW_SB_LUT4_O_18_I3": {
  192596. "hide_name": 0,
  192597. "bits": [ 5286 ],
  192598. "attributes": {
  192599. "abc9_carry": "00000000000000000000000000000001",
  192600. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192601. }
  192602. },
  192603. "cpu_I.memory_MUL_LOW_SB_LUT4_O_19_I1": {
  192604. "hide_name": 0,
  192605. "bits": [ "0", 5288, 5289, 5290 ],
  192606. "attributes": {
  192607. "force_downto": "00000000000000000000000000000001",
  192608. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192609. }
  192610. },
  192611. "cpu_I.memory_MUL_LOW_SB_LUT4_O_19_I3": {
  192612. "hide_name": 0,
  192613. "bits": [ 5290 ],
  192614. "attributes": {
  192615. "abc9_carry": "00000000000000000000000000000001",
  192616. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192617. }
  192618. },
  192619. "cpu_I.memory_MUL_LOW_SB_LUT4_O_1_I1": {
  192620. "hide_name": 0,
  192621. "bits": [ 4987, 5246, 4950, 5247 ],
  192622. "attributes": {
  192623. "force_downto": "00000000000000000000000000000001",
  192624. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192625. }
  192626. },
  192627. "cpu_I.memory_MUL_LOW_SB_LUT4_O_1_I3": {
  192628. "hide_name": 0,
  192629. "bits": [ 5247 ],
  192630. "attributes": {
  192631. "abc9_carry": "00000000000000000000000000000001",
  192632. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192633. }
  192634. },
  192635. "cpu_I.memory_MUL_LOW_SB_LUT4_O_20_I1": {
  192636. "hide_name": 0,
  192637. "bits": [ "0", 5297, 5298, 5299 ],
  192638. "attributes": {
  192639. "force_downto": "00000000000000000000000000000001",
  192640. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192641. }
  192642. },
  192643. "cpu_I.memory_MUL_LOW_SB_LUT4_O_20_I3": {
  192644. "hide_name": 0,
  192645. "bits": [ 5299 ],
  192646. "attributes": {
  192647. "abc9_carry": "00000000000000000000000000000001",
  192648. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192649. }
  192650. },
  192651. "cpu_I.memory_MUL_LOW_SB_LUT4_O_21_I1": {
  192652. "hide_name": 0,
  192653. "bits": [ "0", 5301, 5302, 5303 ],
  192654. "attributes": {
  192655. "force_downto": "00000000000000000000000000000001",
  192656. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192657. }
  192658. },
  192659. "cpu_I.memory_MUL_LOW_SB_LUT4_O_21_I3": {
  192660. "hide_name": 0,
  192661. "bits": [ 5303 ],
  192662. "attributes": {
  192663. "abc9_carry": "00000000000000000000000000000001",
  192664. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192665. }
  192666. },
  192667. "cpu_I.memory_MUL_LOW_SB_LUT4_O_22_I1": {
  192668. "hide_name": 0,
  192669. "bits": [ "0", 5305, 5306, 5307 ],
  192670. "attributes": {
  192671. "force_downto": "00000000000000000000000000000001",
  192672. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192673. }
  192674. },
  192675. "cpu_I.memory_MUL_LOW_SB_LUT4_O_22_I3": {
  192676. "hide_name": 0,
  192677. "bits": [ 5307 ],
  192678. "attributes": {
  192679. "abc9_carry": "00000000000000000000000000000001",
  192680. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192681. }
  192682. },
  192683. "cpu_I.memory_MUL_LOW_SB_LUT4_O_23_I1": {
  192684. "hide_name": 0,
  192685. "bits": [ "0", 5309, 5310, 5311 ],
  192686. "attributes": {
  192687. "force_downto": "00000000000000000000000000000001",
  192688. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192689. }
  192690. },
  192691. "cpu_I.memory_MUL_LOW_SB_LUT4_O_23_I3": {
  192692. "hide_name": 0,
  192693. "bits": [ 5311 ],
  192694. "attributes": {
  192695. "abc9_carry": "00000000000000000000000000000001",
  192696. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192697. }
  192698. },
  192699. "cpu_I.memory_MUL_LOW_SB_LUT4_O_24_I1": {
  192700. "hide_name": 0,
  192701. "bits": [ "0", 5313, 5314, 5315 ],
  192702. "attributes": {
  192703. "force_downto": "00000000000000000000000000000001",
  192704. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192705. }
  192706. },
  192707. "cpu_I.memory_MUL_LOW_SB_LUT4_O_24_I3": {
  192708. "hide_name": 0,
  192709. "bits": [ 5315 ],
  192710. "attributes": {
  192711. "abc9_carry": "00000000000000000000000000000001",
  192712. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192713. }
  192714. },
  192715. "cpu_I.memory_MUL_LOW_SB_LUT4_O_25_I1": {
  192716. "hide_name": 0,
  192717. "bits": [ "0", 5317, 5318, 5319 ],
  192718. "attributes": {
  192719. "force_downto": "00000000000000000000000000000001",
  192720. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192721. }
  192722. },
  192723. "cpu_I.memory_MUL_LOW_SB_LUT4_O_25_I3": {
  192724. "hide_name": 0,
  192725. "bits": [ 5319 ],
  192726. "attributes": {
  192727. "abc9_carry": "00000000000000000000000000000001",
  192728. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192729. }
  192730. },
  192731. "cpu_I.memory_MUL_LOW_SB_LUT4_O_26_I1": {
  192732. "hide_name": 0,
  192733. "bits": [ "0", 5321, 5322, 5323 ],
  192734. "attributes": {
  192735. "force_downto": "00000000000000000000000000000001",
  192736. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192737. }
  192738. },
  192739. "cpu_I.memory_MUL_LOW_SB_LUT4_O_26_I3": {
  192740. "hide_name": 0,
  192741. "bits": [ 5323 ],
  192742. "attributes": {
  192743. "abc9_carry": "00000000000000000000000000000001",
  192744. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192745. }
  192746. },
  192747. "cpu_I.memory_MUL_LOW_SB_LUT4_O_27_I1": {
  192748. "hide_name": 0,
  192749. "bits": [ "0", 5325, 5326, 5327 ],
  192750. "attributes": {
  192751. "force_downto": "00000000000000000000000000000001",
  192752. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192753. }
  192754. },
  192755. "cpu_I.memory_MUL_LOW_SB_LUT4_O_27_I3": {
  192756. "hide_name": 0,
  192757. "bits": [ 5327 ],
  192758. "attributes": {
  192759. "abc9_carry": "00000000000000000000000000000001",
  192760. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192761. }
  192762. },
  192763. "cpu_I.memory_MUL_LOW_SB_LUT4_O_28_I1": {
  192764. "hide_name": 0,
  192765. "bits": [ "0", 5329, 5330, 5331 ],
  192766. "attributes": {
  192767. "force_downto": "00000000000000000000000000000001",
  192768. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192769. }
  192770. },
  192771. "cpu_I.memory_MUL_LOW_SB_LUT4_O_28_I3": {
  192772. "hide_name": 0,
  192773. "bits": [ 5331 ],
  192774. "attributes": {
  192775. "abc9_carry": "00000000000000000000000000000001",
  192776. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192777. }
  192778. },
  192779. "cpu_I.memory_MUL_LOW_SB_LUT4_O_29_I1": {
  192780. "hide_name": 0,
  192781. "bits": [ "0", 5333, 5334, 5335 ],
  192782. "attributes": {
  192783. "force_downto": "00000000000000000000000000000001",
  192784. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192785. }
  192786. },
  192787. "cpu_I.memory_MUL_LOW_SB_LUT4_O_29_I3": {
  192788. "hide_name": 0,
  192789. "bits": [ 5335 ],
  192790. "attributes": {
  192791. "abc9_carry": "00000000000000000000000000000001",
  192792. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192793. }
  192794. },
  192795. "cpu_I.memory_MUL_LOW_SB_LUT4_O_2_I1": {
  192796. "hide_name": 0,
  192797. "bits": [ "0", 5294, 5295, "0" ],
  192798. "attributes": {
  192799. "force_downto": "00000000000000000000000000000001",
  192800. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192801. }
  192802. },
  192803. "cpu_I.memory_MUL_LOW_SB_LUT4_O_30_I1": {
  192804. "hide_name": 0,
  192805. "bits": [ "0", 5341, 5342, 5343 ],
  192806. "attributes": {
  192807. "force_downto": "00000000000000000000000000000001",
  192808. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192809. }
  192810. },
  192811. "cpu_I.memory_MUL_LOW_SB_LUT4_O_30_I3": {
  192812. "hide_name": 0,
  192813. "bits": [ 5343 ],
  192814. "attributes": {
  192815. "abc9_carry": "00000000000000000000000000000001",
  192816. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192817. }
  192818. },
  192819. "cpu_I.memory_MUL_LOW_SB_LUT4_O_31_I1": {
  192820. "hide_name": 0,
  192821. "bits": [ "0", 5345, 5346, 5347 ],
  192822. "attributes": {
  192823. "force_downto": "00000000000000000000000000000001",
  192824. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192825. }
  192826. },
  192827. "cpu_I.memory_MUL_LOW_SB_LUT4_O_31_I3": {
  192828. "hide_name": 0,
  192829. "bits": [ 5347 ],
  192830. "attributes": {
  192831. "abc9_carry": "00000000000000000000000000000001",
  192832. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192833. }
  192834. },
  192835. "cpu_I.memory_MUL_LOW_SB_LUT4_O_32_I1": {
  192836. "hide_name": 0,
  192837. "bits": [ "0", 5349, 5350, 5351 ],
  192838. "attributes": {
  192839. "force_downto": "00000000000000000000000000000001",
  192840. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192841. }
  192842. },
  192843. "cpu_I.memory_MUL_LOW_SB_LUT4_O_32_I3": {
  192844. "hide_name": 0,
  192845. "bits": [ 5351 ],
  192846. "attributes": {
  192847. "abc9_carry": "00000000000000000000000000000001",
  192848. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192849. }
  192850. },
  192851. "cpu_I.memory_MUL_LOW_SB_LUT4_O_33_I2": {
  192852. "hide_name": 0,
  192853. "bits": [ "0", 5246, 5293, 5292 ],
  192854. "attributes": {
  192855. "force_downto": "00000000000000000000000000000001",
  192856. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192857. }
  192858. },
  192859. "cpu_I.memory_MUL_LOW_SB_LUT4_O_33_I3": {
  192860. "hide_name": 0,
  192861. "bits": [ 5292 ],
  192862. "attributes": {
  192863. "abc9_carry": "00000000000000000000000000000001",
  192864. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192865. }
  192866. },
  192867. "cpu_I.memory_MUL_LOW_SB_LUT4_O_3_I1": {
  192868. "hide_name": 0,
  192869. "bits": [ "0", 5337, 5338, 5339 ],
  192870. "attributes": {
  192871. "force_downto": "00000000000000000000000000000001",
  192872. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192873. }
  192874. },
  192875. "cpu_I.memory_MUL_LOW_SB_LUT4_O_3_I3": {
  192876. "hide_name": 0,
  192877. "bits": [ 5339 ],
  192878. "attributes": {
  192879. "abc9_carry": "00000000000000000000000000000001",
  192880. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192881. }
  192882. },
  192883. "cpu_I.memory_MUL_LOW_SB_LUT4_O_4_I1": {
  192884. "hide_name": 0,
  192885. "bits": [ "0", 5355, 5356, 5357 ],
  192886. "attributes": {
  192887. "force_downto": "00000000000000000000000000000001",
  192888. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192889. }
  192890. },
  192891. "cpu_I.memory_MUL_LOW_SB_LUT4_O_4_I3": {
  192892. "hide_name": 0,
  192893. "bits": [ 5357 ],
  192894. "attributes": {
  192895. "abc9_carry": "00000000000000000000000000000001",
  192896. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192897. }
  192898. },
  192899. "cpu_I.memory_MUL_LOW_SB_LUT4_O_5_I1": {
  192900. "hide_name": 0,
  192901. "bits": [ "0", 5359, 5360, 5361 ],
  192902. "attributes": {
  192903. "force_downto": "00000000000000000000000000000001",
  192904. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192905. }
  192906. },
  192907. "cpu_I.memory_MUL_LOW_SB_LUT4_O_5_I3": {
  192908. "hide_name": 0,
  192909. "bits": [ 5361 ],
  192910. "attributes": {
  192911. "abc9_carry": "00000000000000000000000000000001",
  192912. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192913. }
  192914. },
  192915. "cpu_I.memory_MUL_LOW_SB_LUT4_O_6_I1": {
  192916. "hide_name": 0,
  192917. "bits": [ "0", 5363, 5364, 5365 ],
  192918. "attributes": {
  192919. "force_downto": "00000000000000000000000000000001",
  192920. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192921. }
  192922. },
  192923. "cpu_I.memory_MUL_LOW_SB_LUT4_O_6_I3": {
  192924. "hide_name": 0,
  192925. "bits": [ 5365 ],
  192926. "attributes": {
  192927. "abc9_carry": "00000000000000000000000000000001",
  192928. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192929. }
  192930. },
  192931. "cpu_I.memory_MUL_LOW_SB_LUT4_O_7_I1": {
  192932. "hide_name": 0,
  192933. "bits": [ "0", 5367, 5368, 5369 ],
  192934. "attributes": {
  192935. "force_downto": "00000000000000000000000000000001",
  192936. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192937. }
  192938. },
  192939. "cpu_I.memory_MUL_LOW_SB_LUT4_O_7_I3": {
  192940. "hide_name": 0,
  192941. "bits": [ 5369 ],
  192942. "attributes": {
  192943. "abc9_carry": "00000000000000000000000000000001",
  192944. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192945. }
  192946. },
  192947. "cpu_I.memory_MUL_LOW_SB_LUT4_O_8_I1": {
  192948. "hide_name": 0,
  192949. "bits": [ "0", 5371, 5372, 5373 ],
  192950. "attributes": {
  192951. "force_downto": "00000000000000000000000000000001",
  192952. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192953. }
  192954. },
  192955. "cpu_I.memory_MUL_LOW_SB_LUT4_O_8_I3": {
  192956. "hide_name": 0,
  192957. "bits": [ 5373 ],
  192958. "attributes": {
  192959. "abc9_carry": "00000000000000000000000000000001",
  192960. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192961. }
  192962. },
  192963. "cpu_I.memory_MUL_LOW_SB_LUT4_O_9_I1": {
  192964. "hide_name": 0,
  192965. "bits": [ "0", 5254, 5255, 5253 ],
  192966. "attributes": {
  192967. "force_downto": "00000000000000000000000000000001",
  192968. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192969. }
  192970. },
  192971. "cpu_I.memory_MUL_LOW_SB_LUT4_O_9_I3": {
  192972. "hide_name": 0,
  192973. "bits": [ 5253 ],
  192974. "attributes": {
  192975. "abc9_carry": "00000000000000000000000000000001",
  192976. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192977. }
  192978. },
  192979. "cpu_I.memory_MUL_LOW_SB_LUT4_O_I1": {
  192980. "hide_name": 0,
  192981. "bits": [ "0", 5242, 5243, 5244 ],
  192982. "attributes": {
  192983. "force_downto": "00000000000000000000000000000001",
  192984. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  192985. }
  192986. },
  192987. "cpu_I.memory_MUL_LOW_SB_LUT4_O_I3": {
  192988. "hide_name": 0,
  192989. "bits": [ 5244 ],
  192990. "attributes": {
  192991. "abc9_carry": "00000000000000000000000000000001",
  192992. "src": "/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  192993. }
  192994. },
  192995. "cpu_I.memory_PC": {
  192996. "hide_name": 0,
  192997. "bits": [ "0", "0", 5080, 5079, 5078, 5077, 5076, 5075, 5074, 5073, 5072, 5071, 5069, 5068, 5067, 5066, 5065, 5064, 5063, 5062, 5061, 5060, 5087, 5086, 5085, 5084, 5083, 5082, 5081, 5070, 5059, 5058 ],
  192998. "attributes": {
  192999. "hdlname": "cpu_I memory_PC",
  193000. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:825.23-825.32"
  193001. }
  193002. },
  193003. "cpu_I.memory_REGFILE_WRITE_DATA": {
  193004. "hide_name": 0,
  193005. "bits": [ 3180, 3235, 3197, 3274, 3158, 3227, 3242, 3247, 3185, 3252, 3240, 3257, 3262, 3267, 3272, 3089, 3100, 3105, 3112, 3119, 3126, 3223, 3133, 3216, 3140, 3147, 3154, 3168, 3209, 3204, 3190, 3173 ],
  193006. "attributes": {
  193007. "hdlname": "cpu_I memory_REGFILE_WRITE_DATA",
  193008. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:826.23-826.48"
  193009. }
  193010. },
  193011. "cpu_I.memory_REGFILE_WRITE_VALID": {
  193012. "hide_name": 0,
  193013. "bits": [ 4895 ],
  193014. "attributes": {
  193015. "hdlname": "cpu_I memory_REGFILE_WRITE_VALID",
  193016. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:770.23-770.49"
  193017. }
  193018. },
  193019. "cpu_I.memory_SHIFT_CTRL": {
  193020. "hide_name": 0,
  193021. "bits": [ 3096, 3095 ],
  193022. "attributes": {
  193023. "hdlname": "cpu_I memory_SHIFT_CTRL",
  193024. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:778.20-778.37"
  193025. }
  193026. },
  193027. "cpu_I.memory_SHIFT_RIGHT": {
  193028. "hide_name": 0,
  193029. "bits": [ 3176, 3193, 3200, 3212, 3161, 3157, 3150, 3143, 3219, 3136, 3226, 3129, 3122, 3115, 3108, 3094, 3093, 3107, 3114, 3121, 3128, 3225, 3135, 3218, 3142, 3149, 3156, 3160, 3211, 3199, 3192, 3175 ],
  193030. "attributes": {
  193031. "hdlname": "cpu_I memory_SHIFT_RIGHT",
  193032. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:776.23-776.41"
  193033. }
  193034. },
  193035. "cpu_I.memory_arbitration_flushIt": {
  193036. "hide_name": 0,
  193037. "bits": [ "0" ],
  193038. "attributes": {
  193039. "hdlname": "cpu_I memory_arbitration_flushIt",
  193040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:880.23-880.49"
  193041. }
  193042. },
  193043. "cpu_I.memory_arbitration_haltByOther": {
  193044. "hide_name": 0,
  193045. "bits": [ "0" ],
  193046. "attributes": {
  193047. "hdlname": "cpu_I memory_arbitration_haltByOther",
  193048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:878.23-878.53"
  193049. }
  193050. },
  193051. "cpu_I.memory_arbitration_haltItself": {
  193052. "hide_name": 0,
  193053. "bits": [ 1018 ],
  193054. "attributes": {
  193055. "hdlname": "cpu_I memory_arbitration_haltItself",
  193056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:877.23-877.52"
  193057. }
  193058. },
  193059. "cpu_I.memory_arbitration_isStuck": {
  193060. "hide_name": 0,
  193061. "bits": [ 1018 ],
  193062. "attributes": {
  193063. "hdlname": "cpu_I memory_arbitration_isStuck",
  193064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:883.23-883.49"
  193065. }
  193066. },
  193067. "cpu_I.memory_arbitration_isStuckByOthers": {
  193068. "hide_name": 0,
  193069. "bits": [ "0" ],
  193070. "attributes": {
  193071. "hdlname": "cpu_I memory_arbitration_isStuckByOthers",
  193072. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:884.23-884.57"
  193073. }
  193074. },
  193075. "cpu_I.memory_to_writeBack_ENV_CTRL": {
  193076. "hide_name": 0,
  193077. "bits": [ 5377, 5376 ],
  193078. "attributes": {
  193079. "hdlname": "cpu_I memory_to_writeBack_ENV_CTRL",
  193080. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1296.20-1296.48"
  193081. }
  193082. },
  193083. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O": {
  193084. "hide_name": 0,
  193085. "bits": [ 1154, 4449, 1365, 5378 ],
  193086. "attributes": {
  193087. "force_downto": "00000000000000000000000000000001",
  193088. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193089. }
  193090. },
  193091. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_I0_O": {
  193092. "hide_name": 0,
  193093. "bits": [ 5379, 5380, 1020 ],
  193094. "attributes": {
  193095. "force_downto": "00000000000000000000000000000001",
  193096. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193097. }
  193098. },
  193099. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_I0_O_SB_LUT4_I1_O": {
  193100. "hide_name": 0,
  193101. "bits": [ 1534, 1325, 1475 ],
  193102. "attributes": {
  193103. "force_downto": "00000000000000000000000000000001",
  193104. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193105. }
  193106. },
  193107. "cpu_I.memory_to_writeBack_ENV_CTRL_SB_LUT4_I1_O_SB_LUT4_O_I3": {
  193108. "hide_name": 0,
  193109. "bits": [ 1239, 1240, 1241, 5381 ],
  193110. "attributes": {
  193111. "force_downto": "00000000000000000000000000000001",
  193112. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193113. }
  193114. },
  193115. "cpu_I.memory_to_writeBack_INSTRUCTION": {
  193116. "hide_name": 0,
  193117. "bits": [ "x", "x", "x", "x", "x", "x", "x", 2268, 2267, 2266, 2265, 2264, 7158, 7159, 7100, "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 7160, 7161, "x", "x" ],
  193118. "attributes": {
  193119. "hdlname": "cpu_I memory_to_writeBack_INSTRUCTION",
  193120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1268.23-1268.54",
  193121. "unused_bits": "12 13 14 28 29"
  193122. }
  193123. },
  193124. "cpu_I.memory_to_writeBack_IS_MUL": {
  193125. "hide_name": 0,
  193126. "bits": [ 5382 ],
  193127. "attributes": {
  193128. "hdlname": "cpu_I memory_to_writeBack_IS_MUL",
  193129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1253.23-1253.49"
  193130. }
  193131. },
  193132. "cpu_I.memory_to_writeBack_IS_MUL_SB_LUT4_I2_O": {
  193133. "hide_name": 0,
  193134. "bits": [ 3400, 3316, 3296 ],
  193135. "attributes": {
  193136. "force_downto": "00000000000000000000000000000001",
  193137. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193138. }
  193139. },
  193140. "cpu_I.memory_to_writeBack_MEMORY_ADDRESS_LOW": {
  193141. "hide_name": 0,
  193142. "bits": [ 3386, 3385 ],
  193143. "attributes": {
  193144. "hdlname": "cpu_I memory_to_writeBack_MEMORY_ADDRESS_LOW",
  193145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1304.23-1304.61"
  193146. }
  193147. },
  193148. "cpu_I.memory_to_writeBack_MEMORY_ENABLE": {
  193149. "hide_name": 0,
  193150. "bits": [ 5383 ],
  193151. "attributes": {
  193152. "hdlname": "cpu_I memory_to_writeBack_MEMORY_ENABLE",
  193153. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1250.23-1250.56"
  193154. }
  193155. },
  193156. "cpu_I.memory_to_writeBack_MEMORY_READ_DATA": {
  193157. "hide_name": 0,
  193158. "bits": [ 3571, 3495, 3482, 3472, 3459, 3441, 3633, 3635, 3398, 3384, 3486, 3470, 3457, 3444, 3518, 3425, 3413, 3498, 3485, 3471, 3458, 3446, 3607, 3616, 3397, 3303, 3319, 3327, 3336, 3345, 3354, 3363 ],
  193159. "attributes": {
  193160. "hdlname": "cpu_I memory_to_writeBack_MEMORY_READ_DATA",
  193161. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1309.23-1309.59"
  193162. }
  193163. },
  193164. "cpu_I.memory_to_writeBack_MUL_HH": {
  193165. "hide_name": 0,
  193166. "bits": [ 3494, 3481, 3469, 3456, 3440, 3436, 3412, 3395, 3381, 3377, 3547, 3537, 3527, 3516, 3507, 3422, 3418, 3553, 3578, 3586, 3594, 3602, 3611, 3620, 3314, 3311, 3323, 3331, 3340, 3349, 3358, 3367, "x", "x" ],
  193167. "attributes": {
  193168. "hdlname": "cpu_I memory_to_writeBack_MUL_HH",
  193169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1242.23-1242.49"
  193170. }
  193171. },
  193172. "cpu_I.memory_to_writeBack_MUL_LOW": {
  193173. "hide_name": 0,
  193174. "bits": [ 3569, 3491, 3477, 3465, 3452, 3433, 3631, 3408, 3391, 3374, 3562, 3543, 3533, 3523, 3512, 3503, 3415, 3550, 3575, 3584, 3592, 3600, 3609, 3618, 3626, 3307, 3321, 3329, 3338, 3347, 3356, 3365, 3493, 3480, 3468, 3455, 3439, 3435, 3411, 3394, 3380, 3376, 3546, 3536, 3526, 3515, 3506, 3421, 3417, 3552, 3577, 3310 ],
  193175. "attributes": {
  193176. "hdlname": "cpu_I memory_to_writeBack_MUL_LOW",
  193177. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1298.23-1298.50"
  193178. }
  193179. },
  193180. "cpu_I.memory_to_writeBack_PC": {
  193181. "hide_name": 0,
  193182. "bits": [ "0", "0", 2841, 2805, 2827, 2829, 2831, 2833, 3976, 2836, 2838, 2840, 2786, 2788, 2790, 2792, 2794, 2796, 2798, 2800, 2802, 2804, 2808, 2810, 2812, 2814, 2816, 2818, 2820, 2822, 2824, 2826 ],
  193183. "attributes": {
  193184. "hdlname": "cpu_I memory_to_writeBack_PC",
  193185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1284.23-1284.45"
  193186. }
  193187. },
  193188. "cpu_I.memory_to_writeBack_REGFILE_WRITE_VALID": {
  193189. "hide_name": 0,
  193190. "bits": [ 2325 ],
  193191. "attributes": {
  193192. "hdlname": "cpu_I memory_to_writeBack_REGFILE_WRITE_VALID",
  193193. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1281.23-1281.62"
  193194. }
  193195. },
  193196. "cpu_I.reset": {
  193197. "hide_name": 0,
  193198. "bits": [ 127 ],
  193199. "attributes": {
  193200. "hdlname": "cpu_I reset",
  193201. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:365.23-365.28"
  193202. }
  193203. },
  193204. "cpu_I.softwareInterrupt": {
  193205. "hide_name": 0,
  193206. "bits": [ "0" ],
  193207. "attributes": {
  193208. "hdlname": "cpu_I softwareInterrupt",
  193209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:339.23-339.40"
  193210. }
  193211. },
  193212. "cpu_I.timerInterrupt": {
  193213. "hide_name": 0,
  193214. "bits": [ "0" ],
  193215. "attributes": {
  193216. "hdlname": "cpu_I timerInterrupt",
  193217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:338.23-338.37"
  193218. }
  193219. },
  193220. "cpu_I.writeBack_DBusSimplePlugin_rspShifted": {
  193221. "hide_name": 0,
  193222. "bits": [ 7162, 7163, 7164, 7165, 7166, 7167, 7168, 7169, 7170, 7171, 7172, 7173, 7174, 7175, 7176, 7177, 3413, 3498, 3485, 3471, 3458, 3446, 3607, 3616, 3397, 3303, 3319, 3327, 3336, 3345, 3354, 3363 ],
  193223. "attributes": {
  193224. "hdlname": "cpu_I writeBack_DBusSimplePlugin_rspShifted",
  193225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1067.23-1067.60",
  193226. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15"
  193227. }
  193228. },
  193229. "cpu_I.writeBack_ENV_CTRL": {
  193230. "hide_name": 0,
  193231. "bits": [ 5377, 5376 ],
  193232. "attributes": {
  193233. "hdlname": "cpu_I writeBack_ENV_CTRL",
  193234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:755.20-755.38"
  193235. }
  193236. },
  193237. "cpu_I.writeBack_INSTRUCTION": {
  193238. "hide_name": 0,
  193239. "bits": [ "x", "x", "x", "x", "x", "x", "x", 2268, 2267, 2266, 2265, 2264, 7178, 7179, 7100, "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", 7180, 7181, "x", "x" ],
  193240. "attributes": {
  193241. "hdlname": "cpu_I writeBack_INSTRUCTION",
  193242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:854.23-854.44",
  193243. "unused_bits": "12 13 14 28 29"
  193244. }
  193245. },
  193246. "cpu_I.writeBack_IS_MUL": {
  193247. "hide_name": 0,
  193248. "bits": [ 5382 ],
  193249. "attributes": {
  193250. "hdlname": "cpu_I writeBack_IS_MUL",
  193251. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:742.23-742.39"
  193252. }
  193253. },
  193254. "cpu_I.writeBack_MEMORY_ADDRESS_LOW": {
  193255. "hide_name": 0,
  193256. "bits": [ 3386, 3385 ],
  193257. "attributes": {
  193258. "hdlname": "cpu_I writeBack_MEMORY_ADDRESS_LOW",
  193259. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:815.23-815.51"
  193260. }
  193261. },
  193262. "cpu_I.writeBack_MEMORY_ENABLE": {
  193263. "hide_name": 0,
  193264. "bits": [ 5383 ],
  193265. "attributes": {
  193266. "hdlname": "cpu_I writeBack_MEMORY_ENABLE",
  193267. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:814.23-814.46"
  193268. }
  193269. },
  193270. "cpu_I.writeBack_MEMORY_READ_DATA": {
  193271. "hide_name": 0,
  193272. "bits": [ 3571, 3495, 3482, 3472, 3459, 3441, 3633, 3635, 3398, 3384, 3486, 3470, 3457, 3444, 3518, 3425, 3413, 3498, 3485, 3471, 3458, 3446, 3607, 3616, 3397, 3303, 3319, 3327, 3336, 3345, 3354, 3363 ],
  193273. "attributes": {
  193274. "hdlname": "cpu_I writeBack_MEMORY_READ_DATA",
  193275. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:816.23-816.49"
  193276. }
  193277. },
  193278. "cpu_I.writeBack_MUL_HH": {
  193279. "hide_name": 0,
  193280. "bits": [ 3494, 3481, 3469, 3456, 3440, 3436, 3412, 3395, 3381, 3377, 3547, 3537, 3527, 3516, 3507, 3422, 3418, 3553, 3578, 3586, 3594, 3602, 3611, 3620, 3314, 3311, 3323, 3331, 3340, 3349, 3358, 3367, "x", "x" ],
  193281. "attributes": {
  193282. "hdlname": "cpu_I writeBack_MUL_HH",
  193283. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:743.23-743.39"
  193284. }
  193285. },
  193286. "cpu_I.writeBack_MUL_LOW": {
  193287. "hide_name": 0,
  193288. "bits": [ 3569, 3491, 3477, 3465, 3452, 3433, 3631, 3408, 3391, 3374, 3562, 3543, 3533, 3523, 3512, 3503, 3415, 3550, 3575, 3584, 3592, 3600, 3609, 3618, 3626, 3307, 3321, 3329, 3338, 3347, 3356, 3365, 3493, 3480, 3468, 3455, 3439, 3435, 3411, 3394, 3380, 3376, 3546, 3536, 3526, 3515, 3506, 3421, 3417, 3552, 3577, 3310 ],
  193289. "attributes": {
  193290. "hdlname": "cpu_I writeBack_MUL_LOW",
  193291. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:744.23-744.40"
  193292. }
  193293. },
  193294. "cpu_I.writeBack_MulPlugin_result": {
  193295. "hide_name": 0,
  193296. "bits": [ 3569, 3491, 3477, 3465, 3452, 3433, 3631, 3408, 3391, 3374, 3562, 3543, 3533, 3523, 3512, 3503, 3415, 3550, 3575, 3584, 3592, 3600, 3609, 3618, 3626, 3307, 3321, 3329, 3338, 3347, 3356, 3365, 7182, 7183, 7184, 7185, 7186, 7187, 7188, 7189, 7190, 7191, 7192, 7193, 7194, 7195, 7196, 7197, 7198, 7199, 7200, 7201, 7202, 7203, 7204, 7205, 7206, 7207, 7208, 7209, 7210, 7211, 7212, 7213, "x", "x" ],
  193297. "attributes": {
  193298. "hdlname": "cpu_I writeBack_MulPlugin_result",
  193299. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:1215.23-1215.49",
  193300. "unused_bits": "32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63"
  193301. }
  193302. },
  193303. "cpu_I.writeBack_PC": {
  193304. "hide_name": 0,
  193305. "bits": [ "0", "0", 2841, 2805, 2827, 2829, 2831, 2833, 3976, 2836, 2838, 2840, 2786, 2788, 2790, 2792, 2794, 2796, 2798, 2800, 2802, 2804, 2808, 2810, 2812, 2814, 2816, 2818, 2820, 2822, 2824, 2826 ],
  193306. "attributes": {
  193307. "hdlname": "cpu_I writeBack_PC",
  193308. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:853.23-853.35"
  193309. }
  193310. },
  193311. "cpu_I.writeBack_REGFILE_WRITE_VALID": {
  193312. "hide_name": 0,
  193313. "bits": [ 2325 ],
  193314. "attributes": {
  193315. "hdlname": "cpu_I writeBack_REGFILE_WRITE_VALID",
  193316. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:773.23-773.52"
  193317. }
  193318. },
  193319. "cpu_I.writeBack_arbitration_flushIt": {
  193320. "hide_name": 0,
  193321. "bits": [ "0" ],
  193322. "attributes": {
  193323. "hdlname": "cpu_I writeBack_arbitration_flushIt",
  193324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:891.23-891.52"
  193325. }
  193326. },
  193327. "cpu_I.writeBack_arbitration_haltByOther": {
  193328. "hide_name": 0,
  193329. "bits": [ "0" ],
  193330. "attributes": {
  193331. "hdlname": "cpu_I writeBack_arbitration_haltByOther",
  193332. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:889.23-889.56"
  193333. }
  193334. },
  193335. "cpu_I.writeBack_arbitration_haltItself": {
  193336. "hide_name": 0,
  193337. "bits": [ "0" ],
  193338. "attributes": {
  193339. "hdlname": "cpu_I writeBack_arbitration_haltItself",
  193340. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:888.23-888.55"
  193341. }
  193342. },
  193343. "cpu_I.writeBack_arbitration_isFlushed": {
  193344. "hide_name": 0,
  193345. "bits": [ "0" ],
  193346. "attributes": {
  193347. "hdlname": "cpu_I writeBack_arbitration_isFlushed",
  193348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:896.23-896.54"
  193349. }
  193350. },
  193351. "cpu_I.writeBack_arbitration_isMoving": {
  193352. "hide_name": 0,
  193353. "bits": [ "1" ],
  193354. "attributes": {
  193355. "hdlname": "cpu_I writeBack_arbitration_isMoving",
  193356. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:897.23-897.53"
  193357. }
  193358. },
  193359. "cpu_I.writeBack_arbitration_isStuck": {
  193360. "hide_name": 0,
  193361. "bits": [ "0" ],
  193362. "attributes": {
  193363. "hdlname": "cpu_I writeBack_arbitration_isStuck",
  193364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:894.23-894.52"
  193365. }
  193366. },
  193367. "cpu_I.writeBack_arbitration_isStuckByOthers": {
  193368. "hide_name": 0,
  193369. "bits": [ "0" ],
  193370. "attributes": {
  193371. "hdlname": "cpu_I writeBack_arbitration_isStuckByOthers",
  193372. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:895.23-895.60"
  193373. }
  193374. },
  193375. "cpu_I.writeBack_arbitration_removeIt": {
  193376. "hide_name": 0,
  193377. "bits": [ "0" ],
  193378. "attributes": {
  193379. "hdlname": "cpu_I writeBack_arbitration_removeIt",
  193380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/VexRiscv.v:890.23-890.53"
  193381. }
  193382. },
  193383. "d_wb_adr": {
  193384. "hide_name": 0,
  193385. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730, 687, 689, 894, 893, "x", "x", 736, 735 ],
  193386. "attributes": {
  193387. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:78.14-78.22"
  193388. }
  193389. },
  193390. "d_wb_bte": {
  193391. "hide_name": 0,
  193392. "bits": [ "0", "0" ],
  193393. "attributes": {
  193394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:83.14-83.22"
  193395. }
  193396. },
  193397. "d_wb_cti": {
  193398. "hide_name": 0,
  193399. "bits": [ "0", "0", "0" ],
  193400. "attributes": {
  193401. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:84.14-84.22"
  193402. }
  193403. },
  193404. "d_wb_dat_miso": {
  193405. "hide_name": 0,
  193406. "bits": [ 822, 786, 840, 831, 828, 825, 816, 783, 750, 747, 819, 813, 810, 807, 804, 801, 798, 795, 792, 789, 780, 777, 774, 771, 768, 765, 762, 759, 756, 753, 837, 834 ],
  193407. "attributes": {
  193408. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:79.14-79.27"
  193409. }
  193410. },
  193411. "d_wb_dat_mosi": {
  193412. "hide_name": 0,
  193413. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  193414. "attributes": {
  193415. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:80.14-80.27"
  193416. }
  193417. },
  193418. "d_wb_err": {
  193419. "hide_name": 0,
  193420. "bits": [ "0" ],
  193421. "attributes": {
  193422. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:82.14-82.22"
  193423. }
  193424. },
  193425. "d_wb_we": {
  193426. "hide_name": 0,
  193427. "bits": [ 469 ],
  193428. "attributes": {
  193429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:77.14-77.21"
  193430. }
  193431. },
  193432. "hdmi_b": {
  193433. "hide_name": 0,
  193434. "bits": [ 17, 18, 19, 20 ],
  193435. "attributes": {
  193436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:21.20-21.26"
  193437. }
  193438. },
  193439. "hdmi_clk": {
  193440. "hide_name": 0,
  193441. "bits": [ 24 ],
  193442. "attributes": {
  193443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:25.20-25.28"
  193444. }
  193445. },
  193446. "hdmi_de": {
  193447. "hide_name": 0,
  193448. "bits": [ 23 ],
  193449. "attributes": {
  193450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:24.20-24.27"
  193451. }
  193452. },
  193453. "hdmi_g": {
  193454. "hide_name": 0,
  193455. "bits": [ 13, 14, 15, 16 ],
  193456. "attributes": {
  193457. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:20.20-20.26"
  193458. }
  193459. },
  193460. "hdmi_hsync": {
  193461. "hide_name": 0,
  193462. "bits": [ 21 ],
  193463. "attributes": {
  193464. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:22.20-22.30"
  193465. }
  193466. },
  193467. "hdmi_r": {
  193468. "hide_name": 0,
  193469. "bits": [ 9, 10, 11, 12 ],
  193470. "attributes": {
  193471. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:19.20-19.26"
  193472. }
  193473. },
  193474. "hdmi_vsync": {
  193475. "hide_name": 0,
  193476. "bits": [ 22 ],
  193477. "attributes": {
  193478. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:23.20-23.30"
  193479. }
  193480. },
  193481. "i_axi_ar_payload_addr": {
  193482. "hide_name": 0,
  193483. "bits": [ "0", "0", "0", "0", "0", 700, 698, 696, 694, 692, 717, 715, 713, 711, 683, 686, 709, 719, 721, 723, 725, 727, 729, 731, 688, 690, 1566, 1565, 1564, 1560, 737, 1559 ],
  193484. "attributes": {
  193485. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:63.14-63.35"
  193486. }
  193487. },
  193488. "i_axi_ar_payload_burst": {
  193489. "hide_name": 0,
  193490. "bits": [ "1", "0" ],
  193491. "attributes": {
  193492. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:65.14-65.36"
  193493. }
  193494. },
  193495. "i_axi_ar_payload_cache": {
  193496. "hide_name": 0,
  193497. "bits": [ "1", "1", "1", "1" ],
  193498. "attributes": {
  193499. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:66.14-66.36"
  193500. }
  193501. },
  193502. "i_axi_ar_payload_len": {
  193503. "hide_name": 0,
  193504. "bits": [ "1", "1", "1", "0", "0", "0", "0", "0" ],
  193505. "attributes": {
  193506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:64.14-64.34"
  193507. }
  193508. },
  193509. "i_axi_ar_payload_prot": {
  193510. "hide_name": 0,
  193511. "bits": [ "0", "1", "1" ],
  193512. "attributes": {
  193513. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:67.14-67.35"
  193514. }
  193515. },
  193516. "i_axi_ar_valid": {
  193517. "hide_name": 0,
  193518. "bits": [ 738 ],
  193519. "attributes": {
  193520. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:61.14-61.28"
  193521. }
  193522. },
  193523. "i_axi_r_payload_data": {
  193524. "hide_name": 0,
  193525. "bits": [ 821, 785, 839, 830, 827, 824, 815, 782, 749, 746, 818, 812, 809, 806, 803, 800, 797, 794, 791, 788, 779, 776, 773, 770, 767, 764, 761, 758, 755, 752, 836, 833 ],
  193526. "attributes": {
  193527. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:70.14-70.34"
  193528. }
  193529. },
  193530. "i_axi_r_payload_last": {
  193531. "hide_name": 0,
  193532. "bits": [ "0" ],
  193533. "attributes": {
  193534. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:72.14-72.34"
  193535. }
  193536. },
  193537. "i_axi_r_payload_resp": {
  193538. "hide_name": 0,
  193539. "bits": [ "0", "0" ],
  193540. "attributes": {
  193541. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:71.14-71.34"
  193542. }
  193543. },
  193544. "i_axi_r_ready": {
  193545. "hide_name": 0,
  193546. "bits": [ "1" ],
  193547. "attributes": {
  193548. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:69.14-69.27"
  193549. }
  193550. },
  193551. "i_axi_r_valid": {
  193552. "hide_name": 0,
  193553. "bits": [ 843 ],
  193554. "attributes": {
  193555. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:68.14-68.27"
  193556. }
  193557. },
  193558. "memctrl_I.cf_dih": {
  193559. "hide_name": 0,
  193560. "bits": [ 706, 704, 701, 699 ],
  193561. "attributes": {
  193562. "hdlname": "memctrl_I cf_dih",
  193563. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:219.14-219.20"
  193564. }
  193565. },
  193566. "memctrl_I.cf_dil": {
  193567. "hide_name": 0,
  193568. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  193569. "attributes": {
  193570. "hdlname": "memctrl_I cf_dil",
  193571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:220.14-220.20"
  193572. }
  193573. },
  193574. "memctrl_I.cf_wren": {
  193575. "hide_name": 0,
  193576. "bits": [ 5385 ],
  193577. "attributes": {
  193578. "hdlname": "memctrl_I cf_wren",
  193579. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:221.14-221.21"
  193580. }
  193581. },
  193582. "memctrl_I.cf_wren_SB_DFF_Q_D": {
  193583. "hide_name": 0,
  193584. "bits": [ 5384 ],
  193585. "attributes": {
  193586. }
  193587. },
  193588. "memctrl_I.cf_wren_SB_LUT4_I1_O": {
  193589. "hide_name": 0,
  193590. "bits": [ 5391 ],
  193591. "attributes": {
  193592. }
  193593. },
  193594. "memctrl_I.cf_wren_SB_LUT4_I1_O_SB_DFFER_D_Q": {
  193595. "hide_name": 0,
  193596. "bits": [ 5389, 5386, 5390, 5396 ],
  193597. "attributes": {
  193598. "force_downto": "00000000000000000000000000000001",
  193599. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193600. }
  193601. },
  193602. "memctrl_I.clk": {
  193603. "hide_name": 0,
  193604. "bits": [ 42 ],
  193605. "attributes": {
  193606. "hdlname": "memctrl_I clk",
  193607. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:72.13-72.16"
  193608. }
  193609. },
  193610. "memctrl_I.cmd_len_rom[0]": {
  193611. "hide_name": 0,
  193612. "bits": [ "1", "1", "0", "0", "0", "0" ],
  193613. "attributes": {
  193614. "hdlname": "memctrl_I cmd_len_rom[0]",
  193615. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193616. }
  193617. },
  193618. "memctrl_I.cmd_len_rom[10]": {
  193619. "hide_name": 0,
  193620. "bits": [ "1", "0", "0", "0", "0", "0" ],
  193621. "attributes": {
  193622. "hdlname": "memctrl_I cmd_len_rom[10]",
  193623. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193624. }
  193625. },
  193626. "memctrl_I.cmd_len_rom[11]": {
  193627. "hide_name": 0,
  193628. "bits": [ "1", "1", "0", "0", "0", "0" ],
  193629. "attributes": {
  193630. "hdlname": "memctrl_I cmd_len_rom[11]",
  193631. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193632. }
  193633. },
  193634. "memctrl_I.cmd_len_rom[12]": {
  193635. "hide_name": 0,
  193636. "bits": [ "1", "0", "1", "1", "1", "1" ],
  193637. "attributes": {
  193638. "hdlname": "memctrl_I cmd_len_rom[12]",
  193639. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193640. }
  193641. },
  193642. "memctrl_I.cmd_len_rom[13]": {
  193643. "hide_name": 0,
  193644. "bits": [ "1", "1", "1", "1", "1", "1" ],
  193645. "attributes": {
  193646. "hdlname": "memctrl_I cmd_len_rom[13]",
  193647. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193648. }
  193649. },
  193650. "memctrl_I.cmd_len_rom[14]": {
  193651. "hide_name": 0,
  193652. "bits": [ "1", "0", "0", "0", "0", "0" ],
  193653. "attributes": {
  193654. "hdlname": "memctrl_I cmd_len_rom[14]",
  193655. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193656. }
  193657. },
  193658. "memctrl_I.cmd_len_rom[15]": {
  193659. "hide_name": 0,
  193660. "bits": [ "1", "1", "0", "0", "0", "0" ],
  193661. "attributes": {
  193662. "hdlname": "memctrl_I cmd_len_rom[15]",
  193663. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193664. }
  193665. },
  193666. "memctrl_I.cmd_len_rom[1]": {
  193667. "hide_name": 0,
  193668. "bits": [ "1", "1", "0", "1", "0", "0" ],
  193669. "attributes": {
  193670. "hdlname": "memctrl_I cmd_len_rom[1]",
  193671. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193672. }
  193673. },
  193674. "memctrl_I.cmd_len_rom[2]": {
  193675. "hide_name": 0,
  193676. "bits": [ "1", "1", "0", "0", "1", "0" ],
  193677. "attributes": {
  193678. "hdlname": "memctrl_I cmd_len_rom[2]",
  193679. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193680. }
  193681. },
  193682. "memctrl_I.cmd_len_rom[3]": {
  193683. "hide_name": 0,
  193684. "bits": [ "1", "1", "0", "1", "1", "0" ],
  193685. "attributes": {
  193686. "hdlname": "memctrl_I cmd_len_rom[3]",
  193687. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193688. }
  193689. },
  193690. "memctrl_I.cmd_len_rom[4]": {
  193691. "hide_name": 0,
  193692. "bits": [ "1", "0", "1", "1", "1", "1" ],
  193693. "attributes": {
  193694. "hdlname": "memctrl_I cmd_len_rom[4]",
  193695. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193696. }
  193697. },
  193698. "memctrl_I.cmd_len_rom[5]": {
  193699. "hide_name": 0,
  193700. "bits": [ "1", "1", "1", "1", "1", "1" ],
  193701. "attributes": {
  193702. "hdlname": "memctrl_I cmd_len_rom[5]",
  193703. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193704. }
  193705. },
  193706. "memctrl_I.cmd_len_rom[6]": {
  193707. "hide_name": 0,
  193708. "bits": [ "1", "0", "0", "0", "0", "0" ],
  193709. "attributes": {
  193710. "hdlname": "memctrl_I cmd_len_rom[6]",
  193711. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193712. }
  193713. },
  193714. "memctrl_I.cmd_len_rom[7]": {
  193715. "hide_name": 0,
  193716. "bits": [ "1", "1", "0", "0", "0", "0" ],
  193717. "attributes": {
  193718. "hdlname": "memctrl_I cmd_len_rom[7]",
  193719. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193720. }
  193721. },
  193722. "memctrl_I.cmd_len_rom[8]": {
  193723. "hide_name": 0,
  193724. "bits": [ "1", "0", "1", "1", "1", "1" ],
  193725. "attributes": {
  193726. "hdlname": "memctrl_I cmd_len_rom[8]",
  193727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193728. }
  193729. },
  193730. "memctrl_I.cmd_len_rom[9]": {
  193731. "hide_name": 0,
  193732. "bits": [ "1", "1", "1", "1", "1", "1" ],
  193733. "attributes": {
  193734. "hdlname": "memctrl_I cmd_len_rom[9]",
  193735. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:528.12-528.23"
  193736. }
  193737. },
  193738. "memctrl_I.dly_si_dst.clk": {
  193739. "hide_name": 0,
  193740. "bits": [ 42 ],
  193741. "attributes": {
  193742. "hdlname": "memctrl_I dly_si_dst clk",
  193743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:52.14-52.17"
  193744. }
  193745. },
  193746. "memctrl_I.dly_si_dst.d": {
  193747. "hide_name": 0,
  193748. "bits": [ 5399, 5397 ],
  193749. "attributes": {
  193750. "hdlname": "memctrl_I dly_si_dst d",
  193751. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:50.26-50.27"
  193752. }
  193753. },
  193754. "memctrl_I.dly_si_dst.dl[0]": {
  193755. "hide_name": 0,
  193756. "bits": [ 5400, 5398 ],
  193757. "attributes": {
  193758. "hdlname": "memctrl_I dly_si_dst dl[0]",
  193759. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:56.18-56.20"
  193760. }
  193761. },
  193762. "memctrl_I.dly_si_dst.dl[1]": {
  193763. "hide_name": 0,
  193764. "bits": [ 5402, 5401 ],
  193765. "attributes": {
  193766. "hdlname": "memctrl_I dly_si_dst dl[1]",
  193767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:56.18-56.20"
  193768. }
  193769. },
  193770. "memctrl_I.dly_si_dst.dl[2]": {
  193771. "hide_name": 0,
  193772. "bits": [ 640, 646 ],
  193773. "attributes": {
  193774. "hdlname": "memctrl_I dly_si_dst dl[2]",
  193775. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:56.18-56.20"
  193776. }
  193777. },
  193778. "memctrl_I.dly_si_dst.dl[3]": {
  193779. "hide_name": 0,
  193780. "bits": [ 641, 230 ],
  193781. "attributes": {
  193782. "hdlname": "memctrl_I dly_si_dst dl[3]",
  193783. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:56.18-56.20"
  193784. }
  193785. },
  193786. "memctrl_I.dly_si_dst.q": {
  193787. "hide_name": 0,
  193788. "bits": [ 641, 230 ],
  193789. "attributes": {
  193790. "hdlname": "memctrl_I dly_si_dst q",
  193791. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:51.26-51.27"
  193792. }
  193793. },
  193794. "memctrl_I.dly_si_mode.clk": {
  193795. "hide_name": 0,
  193796. "bits": [ 42 ],
  193797. "attributes": {
  193798. "hdlname": "memctrl_I dly_si_mode clk",
  193799. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:23.14-23.17"
  193800. }
  193801. },
  193802. "memctrl_I.dly_si_mode.d": {
  193803. "hide_name": 0,
  193804. "bits": [ 5404 ],
  193805. "attributes": {
  193806. "hdlname": "memctrl_I dly_si_mode d",
  193807. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:21.14-21.15"
  193808. }
  193809. },
  193810. "memctrl_I.dly_si_mode.dl": {
  193811. "hide_name": 0,
  193812. "bits": [ 5408, 5406, 5407, 5409 ],
  193813. "attributes": {
  193814. "hdlname": "memctrl_I dly_si_mode dl",
  193815. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:26.18-26.20"
  193816. }
  193817. },
  193818. "memctrl_I.dly_si_mode.q": {
  193819. "hide_name": 0,
  193820. "bits": [ 5409 ],
  193821. "attributes": {
  193822. "hdlname": "memctrl_I dly_si_mode q",
  193823. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:22.14-22.15"
  193824. }
  193825. },
  193826. "memctrl_I.ectl_cs": {
  193827. "hide_name": 0,
  193828. "bits": [ 5413, 5411 ],
  193829. "attributes": {
  193830. "hdlname": "memctrl_I ectl_cs",
  193831. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:241.14-241.21"
  193832. }
  193833. },
  193834. "memctrl_I.ectl_cs_SB_DFF_Q_1_D": {
  193835. "hide_name": 0,
  193836. "bits": [ 5412 ],
  193837. "attributes": {
  193838. }
  193839. },
  193840. "memctrl_I.ectl_cs_SB_DFF_Q_D": {
  193841. "hide_name": 0,
  193842. "bits": [ 5410 ],
  193843. "attributes": {
  193844. }
  193845. },
  193846. "memctrl_I.ectl_cs_SB_DFF_Q_D_SB_LUT4_O_I3": {
  193847. "hide_name": 0,
  193848. "bits": [ 70, 5411, 5414 ],
  193849. "attributes": {
  193850. "force_downto": "00000000000000000000000000000001",
  193851. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193852. }
  193853. },
  193854. "memctrl_I.ectl_grant": {
  193855. "hide_name": 0,
  193856. "bits": [ 5389 ],
  193857. "attributes": {
  193858. "hdlname": "memctrl_I ectl_grant",
  193859. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:243.14-243.24"
  193860. }
  193861. },
  193862. "memctrl_I.ectl_grant_SB_LUT4_I1_1_O": {
  193863. "hide_name": 0,
  193864. "bits": [ 155, 5420, 5419, 5418 ],
  193865. "attributes": {
  193866. "force_downto": "00000000000000000000000000000001",
  193867. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193868. }
  193869. },
  193870. "memctrl_I.ectl_grant_SB_LUT4_I1_O": {
  193871. "hide_name": 0,
  193872. "bits": [ 193, 5421, 5418, 122 ],
  193873. "attributes": {
  193874. "force_downto": "00000000000000000000000000000001",
  193875. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193876. }
  193877. },
  193878. "memctrl_I.ectl_idle": {
  193879. "hide_name": 0,
  193880. "bits": [ 133 ],
  193881. "attributes": {
  193882. "hdlname": "memctrl_I ectl_idle",
  193883. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:244.14-244.23"
  193884. }
  193885. },
  193886. "memctrl_I.ectl_req": {
  193887. "hide_name": 0,
  193888. "bits": [ 5423 ],
  193889. "attributes": {
  193890. "hdlname": "memctrl_I ectl_req",
  193891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:242.14-242.22"
  193892. }
  193893. },
  193894. "memctrl_I.ectl_req_SB_DFFSR_Q_D": {
  193895. "hide_name": 0,
  193896. "bits": [ 5422 ],
  193897. "attributes": {
  193898. }
  193899. },
  193900. "memctrl_I.genblk1.cmd_fifo_I.ce": {
  193901. "hide_name": 0,
  193902. "bits": [ "x", 5392, "x" ],
  193903. "attributes": {
  193904. "hdlname": "memctrl_I genblk1.cmd_fifo_I ce",
  193905. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:38.20-38.22"
  193906. }
  193907. },
  193908. "memctrl_I.genblk1.cmd_fifo_I.ce_SB_LUT4_O_I3": {
  193909. "hide_name": 0,
  193910. "bits": [ 127, 5393, 5424, 463 ],
  193911. "attributes": {
  193912. "force_downto": "00000000000000000000000000000001",
  193913. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193914. }
  193915. },
  193916. "memctrl_I.genblk1.cmd_fifo_I.clk": {
  193917. "hide_name": 0,
  193918. "bits": [ 42 ],
  193919. "attributes": {
  193920. "hdlname": "memctrl_I genblk1.cmd_fifo_I clk",
  193921. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:31.14-31.17"
  193922. }
  193923. },
  193924. "memctrl_I.genblk1.cmd_fifo_I.data[0]": {
  193925. "hide_name": 0,
  193926. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  193927. "attributes": {
  193928. "hdlname": "memctrl_I genblk1.cmd_fifo_I data[0]",
  193929. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:40.20-40.24"
  193930. }
  193931. },
  193932. "memctrl_I.genblk1.cmd_fifo_I.data[2]": {
  193933. "hide_name": 0,
  193934. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110, 706, 704, 701, 699 ],
  193935. "attributes": {
  193936. "hdlname": "memctrl_I genblk1.cmd_fifo_I data[2]",
  193937. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:40.20-40.24"
  193938. }
  193939. },
  193940. "memctrl_I.genblk1.cmd_fifo_I.rst": {
  193941. "hide_name": 0,
  193942. "bits": [ 127 ],
  193943. "attributes": {
  193944. "hdlname": "memctrl_I genblk1.cmd_fifo_I rst",
  193945. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:32.14-32.17"
  193946. }
  193947. },
  193948. "memctrl_I.genblk1.cmd_fifo_I.valid": {
  193949. "hide_name": 0,
  193950. "bits": [ "1", 7214, "0" ],
  193951. "attributes": {
  193952. "hdlname": "memctrl_I genblk1.cmd_fifo_I valid",
  193953. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:39.20-39.25",
  193954. "unused_bits": "1 "
  193955. }
  193956. },
  193957. "memctrl_I.genblk1.cmd_fifo_I.wr_data": {
  193958. "hide_name": 0,
  193959. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110, 706, 704, 701, 699 ],
  193960. "attributes": {
  193961. "hdlname": "memctrl_I genblk1.cmd_fifo_I wr_data",
  193962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:23.26-23.33"
  193963. }
  193964. },
  193965. "memctrl_I.genblk1.cmd_fifo_I.wr_ena": {
  193966. "hide_name": 0,
  193967. "bits": [ 5385 ],
  193968. "attributes": {
  193969. "hdlname": "memctrl_I genblk1.cmd_fifo_I wr_ena",
  193970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:24.14-24.20"
  193971. }
  193972. },
  193973. "memctrl_I.genblk1.rsp_fifo_I.ce": {
  193974. "hide_name": 0,
  193975. "bits": [ "x", 644, "x" ],
  193976. "attributes": {
  193977. "hdlname": "memctrl_I genblk1.rsp_fifo_I ce",
  193978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:38.20-38.22"
  193979. }
  193980. },
  193981. "memctrl_I.genblk1.rsp_fifo_I.ce_SB_LUT4_O_I3": {
  193982. "hide_name": 0,
  193983. "bits": [ 645, 642, 5425 ],
  193984. "attributes": {
  193985. "force_downto": "00000000000000000000000000000001",
  193986. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  193987. }
  193988. },
  193989. "memctrl_I.genblk1.rsp_fifo_I.clk": {
  193990. "hide_name": 0,
  193991. "bits": [ 42 ],
  193992. "attributes": {
  193993. "hdlname": "memctrl_I genblk1.rsp_fifo_I clk",
  193994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:31.14-31.17"
  193995. }
  193996. },
  193997. "memctrl_I.genblk1.rsp_fifo_I.data[0]": {
  193998. "hide_name": 0,
  193999. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194000. "attributes": {
  194001. "hdlname": "memctrl_I genblk1.rsp_fifo_I data[0]",
  194002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:40.20-40.24"
  194003. }
  194004. },
  194005. "memctrl_I.genblk1.rsp_fifo_I.data[1]": {
  194006. "hide_name": 0,
  194007. "bits": [ 7215, 7216, 7217, 5440, 7218, 7219, 5439, 5437, 5436, 5435, 7220, 7221, 5434, 7222, 7223, 7224, 5433, 5432, 5431, 5430, 5429, 5428, 5447, 5446, 5445, 5444, 5443, 5442, 5441, 5438, 5427, 5426 ],
  194008. "attributes": {
  194009. "hdlname": "memctrl_I genblk1.rsp_fifo_I data[1]",
  194010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:40.20-40.24",
  194011. "unused_bits": "0 1 2 4 5 10 11 13 14 15"
  194012. }
  194013. },
  194014. "memctrl_I.genblk1.rsp_fifo_I.data[2]": {
  194015. "hide_name": 0,
  194016. "bits": [ 218, 217, 216, 225, 273, 272, 271, 280, 222, 221, 220, 219, 277, 276, 275, 274, 211, 210, 224, 223, 266, 265, 279, 278, 215, 214, 213, 212, 270, 269, 268, 267 ],
  194017. "attributes": {
  194018. "hdlname": "memctrl_I genblk1.rsp_fifo_I data[2]",
  194019. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:40.20-40.24"
  194020. }
  194021. },
  194022. "memctrl_I.genblk1.rsp_fifo_I.rd_data": {
  194023. "hide_name": 0,
  194024. "bits": [ 7215, 7216, 7217, 5440, 7218, 7219, 5439, 5437, 5436, 5435, 7220, 7221, 5434, 7222, 7223, 7224, 5433, 5432, 5431, 5430, 5429, 5428, 5447, 5446, 5445, 5444, 5443, 5442, 5441, 5438, 5427, 5426 ],
  194025. "attributes": {
  194026. "hdlname": "memctrl_I genblk1.rsp_fifo_I rd_data",
  194027. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:27.26-27.33",
  194028. "unused_bits": "0 1 2 4 5 10 11 13 14 15"
  194029. }
  194030. },
  194031. "memctrl_I.genblk1.rsp_fifo_I.rst": {
  194032. "hide_name": 0,
  194033. "bits": [ 127 ],
  194034. "attributes": {
  194035. "hdlname": "memctrl_I genblk1.rsp_fifo_I rst",
  194036. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:32.14-32.17"
  194037. }
  194038. },
  194039. "memctrl_I.genblk1.rsp_fifo_I.stage[1].l_data": {
  194040. "hide_name": 0,
  194041. "bits": [ 7215, 7216, 7217, 5440, 7218, 7219, 5439, 5437, 5436, 5435, 7220, 7221, 5434, 7222, 7223, 7224, 5433, 5432, 5431, 5430, 5429, 5428, 5447, 5446, 5445, 5444, 5443, 5442, 5441, 5438, 5427, 5426 ],
  194042. "attributes": {
  194043. "hdlname": "memctrl_I genblk1.rsp_fifo_I stage[1].l_data",
  194044. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:53.20-53.26",
  194045. "unused_bits": "0 1 2 4 5 10 11 13 14 15"
  194046. }
  194047. },
  194048. "memctrl_I.genblk1.rsp_fifo_I.valid": {
  194049. "hide_name": 0,
  194050. "bits": [ "1", 7225, "0" ],
  194051. "attributes": {
  194052. "hdlname": "memctrl_I genblk1.rsp_fifo_I valid",
  194053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:39.20-39.25",
  194054. "unused_bits": "1 "
  194055. }
  194056. },
  194057. "memctrl_I.genblk1.rsp_fifo_I.wr_data": {
  194058. "hide_name": 0,
  194059. "bits": [ 218, 217, 216, 225, 273, 272, 271, 280, 222, 221, 220, 219, 277, 276, 275, 274, 211, 210, 224, 223, 266, 265, 279, 278, 215, 214, 213, 212, 270, 269, 268, 267 ],
  194060. "attributes": {
  194061. "hdlname": "memctrl_I genblk1.rsp_fifo_I wr_data",
  194062. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_shift.v:23.26-23.33"
  194063. }
  194064. },
  194065. "memctrl_I.mi_addr": {
  194066. "hide_name": 0,
  194067. "bits": [ "0", "0", "0", "0", "0", 152, 153, 154, 155, 156, 157, 158, 159, 160, 6923, 6924, 6925, 6926, 6927, 6928, 6929, 6930, 6931, 6932 ],
  194068. "attributes": {
  194069. "hdlname": "memctrl_I mi_addr",
  194070. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:49.21-49.28",
  194071. "unused_bits": "14 15 16 17 18 19 20 21 22 23"
  194072. }
  194073. },
  194074. "memctrl_I.mi_addr_cs": {
  194075. "hide_name": 0,
  194076. "bits": [ 6933, 6934 ],
  194077. "attributes": {
  194078. "hdlname": "memctrl_I mi_addr_cs",
  194079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:48.21-48.31",
  194080. "unused_bits": "0 1"
  194081. }
  194082. },
  194083. "memctrl_I.mi_len": {
  194084. "hide_name": 0,
  194085. "bits": [ "1", "1", "1", "0", "0", "0", "0" ],
  194086. "attributes": {
  194087. "hdlname": "memctrl_I mi_len",
  194088. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:50.21-50.27"
  194089. }
  194090. },
  194091. "memctrl_I.mi_rdata": {
  194092. "hide_name": 0,
  194093. "bits": [ 218, 217, 216, 225, 273, 272, 271, 280, 222, 221, 220, 219, 277, 276, 275, 274, 211, 210, 224, 223, 266, 265, 279, 278, 215, 214, 213, 212, 270, 269, 268, 267 ],
  194094. "attributes": {
  194095. "hdlname": "memctrl_I mi_rdata",
  194096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:59.21-59.29"
  194097. }
  194098. },
  194099. "memctrl_I.mi_ready": {
  194100. "hide_name": 0,
  194101. "bits": [ 133 ],
  194102. "attributes": {
  194103. "hdlname": "memctrl_I mi_ready",
  194104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:53.21-53.29"
  194105. }
  194106. },
  194107. "memctrl_I.mi_rlast": {
  194108. "hide_name": 0,
  194109. "bits": [ 641 ],
  194110. "attributes": {
  194111. "hdlname": "memctrl_I mi_rlast",
  194112. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:61.21-61.29"
  194113. }
  194114. },
  194115. "memctrl_I.mi_rstb": {
  194116. "hide_name": 0,
  194117. "bits": [ 230 ],
  194118. "attributes": {
  194119. "hdlname": "memctrl_I mi_rstb",
  194120. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:60.21-60.28"
  194121. }
  194122. },
  194123. "memctrl_I.mi_spi_cmd": {
  194124. "hide_name": 0,
  194125. "bits": [ 7226, 7227, "0", 7226, "0", 7228, 7228, 7228 ],
  194126. "attributes": {
  194127. "hdlname": "memctrl_I mi_spi_cmd",
  194128. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:268.14-268.24",
  194129. "unused_bits": "0 1 3 5 6 7"
  194130. }
  194131. },
  194132. "memctrl_I.mi_wdata": {
  194133. "hide_name": 0,
  194134. "bits": [ 192, 193, 194, 195, 261, 262, 263, 264, 188, 189, 190, 191, 257, 258, 259, 260, 184, 185, 186, 187, 253, 254, 255, 256, 180, 181, 182, 183, 249, 250, 251, 252 ],
  194135. "attributes": {
  194136. "hdlname": "memctrl_I mi_wdata",
  194137. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:55.21-55.29"
  194138. }
  194139. },
  194140. "memctrl_I.mi_wlast": {
  194141. "hide_name": 0,
  194142. "bits": [ 120 ],
  194143. "attributes": {
  194144. "hdlname": "memctrl_I mi_wlast",
  194145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:57.21-57.29"
  194146. }
  194147. },
  194148. "memctrl_I.pause_cnt": {
  194149. "hide_name": 0,
  194150. "bits": [ 5449, 5455, 5453, 5457 ],
  194151. "attributes": {
  194152. "hdlname": "memctrl_I pause_cnt",
  194153. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:264.14-264.23"
  194154. }
  194155. },
  194156. "memctrl_I.pause_cnt_SB_DFFSR_Q_R": {
  194157. "hide_name": 0,
  194158. "bits": [ 5450 ],
  194159. "attributes": {
  194160. }
  194161. },
  194162. "memctrl_I.pause_last": {
  194163. "hide_name": 0,
  194164. "bits": [ 5457 ],
  194165. "attributes": {
  194166. "hdlname": "memctrl_I pause_last",
  194167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:265.14-265.24"
  194168. }
  194169. },
  194170. "memctrl_I.pause_last_SB_LUT4_I1_I3": {
  194171. "hide_name": 0,
  194172. "bits": [ 5458 ],
  194173. "attributes": {
  194174. "abc9_carry": "00000000000000000000000000000001",
  194175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  194176. }
  194177. },
  194178. "memctrl_I.pause_last_SB_LUT4_I1_O": {
  194179. "hide_name": 0,
  194180. "bits": [ 5448, 5454, 5452, 5456 ],
  194181. "attributes": {
  194182. "force_downto": "00000000000000000000000000000001",
  194183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  194184. }
  194185. },
  194186. "memctrl_I.pause_last_SB_LUT4_I1_O_SB_LUT4_O_1_I3": {
  194187. "hide_name": 0,
  194188. "bits": [ 5459 ],
  194189. "attributes": {
  194190. "abc9_carry": "00000000000000000000000000000001",
  194191. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:517.17-517.30|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  194192. }
  194193. },
  194194. "memctrl_I.pause_last_SB_LUT4_I3_1_O": {
  194195. "hide_name": 0,
  194196. "bits": [ 5389, 127, 5464, 5463 ],
  194197. "attributes": {
  194198. "force_downto": "00000000000000000000000000000001",
  194199. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194200. }
  194201. },
  194202. "memctrl_I.pause_last_SB_LUT4_I3_O": {
  194203. "hide_name": 0,
  194204. "bits": [ 5423, 133, 5460, 5465 ],
  194205. "attributes": {
  194206. "force_downto": "00000000000000000000000000000001",
  194207. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194208. }
  194209. },
  194210. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O": {
  194211. "hide_name": 0,
  194212. "bits": [ 639, 5467, 5469, 5474, 5416, 5472, 5470 ],
  194213. "attributes": {
  194214. }
  194215. },
  194216. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_1_I3": {
  194217. "hide_name": 0,
  194218. "bits": [ 127, 133, 647, 5468 ],
  194219. "attributes": {
  194220. "force_downto": "00000000000000000000000000000001",
  194221. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194222. }
  194223. },
  194224. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  194225. "hide_name": 0,
  194226. "bits": [ 5461, 127, 5462, 5471 ],
  194227. "attributes": {
  194228. "force_downto": "00000000000000000000000000000001",
  194229. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194230. }
  194231. },
  194232. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  194233. "hide_name": 0,
  194234. "bits": [ 5389, 127, 5464, 5473 ],
  194235. "attributes": {
  194236. "force_downto": "00000000000000000000000000000001",
  194237. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194238. }
  194239. },
  194240. "memctrl_I.pause_last_SB_LUT4_I3_O_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  194241. "hide_name": 0,
  194242. "bits": [ 127, 5393, 5424, 5466 ],
  194243. "attributes": {
  194244. "force_downto": "00000000000000000000000000000001",
  194245. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194246. }
  194247. },
  194248. "memctrl_I.phy_clk_o": {
  194249. "hide_name": 0,
  194250. "bits": [ 5947, 5947, 5461, 5461 ],
  194251. "attributes": {
  194252. "hdlname": "memctrl_I phy_clk_o",
  194253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:44.25-44.34"
  194254. }
  194255. },
  194256. "memctrl_I.phy_cs_o": {
  194257. "hide_name": 0,
  194258. "bits": [ 5478, 5476 ],
  194259. "attributes": {
  194260. "hdlname": "memctrl_I phy_cs_o",
  194261. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:45.25-45.33"
  194262. }
  194263. },
  194264. "memctrl_I.phy_cs_o_SB_DFFSS_Q_1_D": {
  194265. "hide_name": 0,
  194266. "bits": [ 5477 ],
  194267. "attributes": {
  194268. }
  194269. },
  194270. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D": {
  194271. "hide_name": 0,
  194272. "bits": [ 5475 ],
  194273. "attributes": {
  194274. }
  194275. },
  194276. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3": {
  194277. "hide_name": 0,
  194278. "bits": [ 5476, 5479, 5481 ],
  194279. "attributes": {
  194280. "force_downto": "00000000000000000000000000000001",
  194281. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194282. }
  194283. },
  194284. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0": {
  194285. "hide_name": 0,
  194286. "bits": [ 5482, 5483, 5465, 5484 ],
  194287. "attributes": {
  194288. "force_downto": "00000000000000000000000000000001",
  194289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194290. }
  194291. },
  194292. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3": {
  194293. "hide_name": 0,
  194294. "bits": [ 5413, 5423, 5485 ],
  194295. "attributes": {
  194296. "force_downto": "00000000000000000000000000000001",
  194297. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194298. }
  194299. },
  194300. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I2": {
  194301. "hide_name": 0,
  194302. "bits": [ "0", "0", 5486, 5487 ],
  194303. "attributes": {
  194304. "force_downto": "00000000000000000000000000000001",
  194305. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194306. }
  194307. },
  194308. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  194309. "hide_name": 0,
  194310. "bits": [ 5487 ],
  194311. "attributes": {
  194312. "abc9_carry": "00000000000000000000000000000001",
  194313. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  194314. }
  194315. },
  194316. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO": {
  194317. "hide_name": 0,
  194318. "bits": [ 5488 ],
  194319. "attributes": {
  194320. "abc9_carry": "00000000000000000000000000000001",
  194321. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  194322. }
  194323. },
  194324. "memctrl_I.phy_cs_o_SB_DFFSS_Q_D_SB_LUT4_O_I3_SB_LUT4_O_I0_SB_LUT4_O_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  194325. "hide_name": 0,
  194326. "bits": [ 5489, 5483, 5465, 5923 ],
  194327. "attributes": {
  194328. "force_downto": "00000000000000000000000000000001",
  194329. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194330. }
  194331. },
  194332. "memctrl_I.phy_io_i": {
  194333. "hide_name": 0,
  194334. "bits": [ 5678, 5680, 5681, 5682, 5679, 5725, 5726, 5727, 5785, 5786, 5787, 5788, 5906, 5907, 5908, 5909 ],
  194335. "attributes": {
  194336. "hdlname": "memctrl_I phy_io_i",
  194337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:41.25-41.33"
  194338. }
  194339. },
  194340. "memctrl_I.phy_io_o": {
  194341. "hide_name": 0,
  194342. "bits": [ 5683, 5686, 5689, 5692, 5729, 5736, 5747, 5685, 5790, 5798, 5804, 5688, 5910, 5913, 5919, 5691 ],
  194343. "attributes": {
  194344. "hdlname": "memctrl_I phy_io_o",
  194345. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:42.25-42.33"
  194346. }
  194347. },
  194348. "memctrl_I.phy_io_oe": {
  194349. "hide_name": 0,
  194350. "bits": [ 5702, 5612, 5612, 5612 ],
  194351. "attributes": {
  194352. "hdlname": "memctrl_I phy_io_oe",
  194353. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:43.25-43.34"
  194354. }
  194355. },
  194356. "memctrl_I.rf_di": {
  194357. "hide_name": 0,
  194358. "bits": [ 218, 217, 216, 225, 273, 272, 271, 280, 222, 221, 220, 219, 277, 276, 275, 274, 211, 210, 224, 223, 266, 265, 279, 278, 215, 214, 213, 212, 270, 269, 268, 267 ],
  194359. "attributes": {
  194360. "hdlname": "memctrl_I rf_di",
  194361. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:228.14-228.19"
  194362. }
  194363. },
  194364. "memctrl_I.rf_do": {
  194365. "hide_name": 0,
  194366. "bits": [ 7215, 7216, 7217, 5440, 7218, 7219, 5439, 5437, 5436, 5435, 7220, 7221, 5434, 7222, 7223, 7224, 5433, 5432, 5431, 5430, 5429, 5428, 5447, 5446, 5445, 5444, 5443, 5442, 5441, 5438, 5427, 5426 ],
  194367. "attributes": {
  194368. "hdlname": "memctrl_I rf_do",
  194369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:232.14-232.19",
  194370. "unused_bits": "0 1 2 4 5 10 11 13 14 15"
  194371. }
  194372. },
  194373. "memctrl_I.rf_overflow": {
  194374. "hide_name": 0,
  194375. "bits": [ 5491 ],
  194376. "attributes": {
  194377. "hdlname": "memctrl_I rf_overflow",
  194378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:236.14-236.25"
  194379. }
  194380. },
  194381. "memctrl_I.rf_overflow_SB_DFF_Q_D": {
  194382. "hide_name": 0,
  194383. "bits": [ 5490 ],
  194384. "attributes": {
  194385. }
  194386. },
  194387. "memctrl_I.rf_overflow_SB_LUT4_I1_I3": {
  194388. "hide_name": 0,
  194389. "bits": [ 5491, 704, 5492 ],
  194390. "attributes": {
  194391. "force_downto": "00000000000000000000000000000001",
  194392. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194393. }
  194394. },
  194395. "memctrl_I.rf_overflow_SB_LUT4_I1_O": {
  194396. "hide_name": 0,
  194397. "bits": [ 5511, 5505, 5503, 7229, 5501, 5499, 7230, 7231, 7232, 7233, 5509, 5495, 7234, 5493, 5507, 5497 ],
  194398. "attributes": {
  194399. "unused_bits": "3 6 7 8 9 12"
  194400. }
  194401. },
  194402. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_1_I2": {
  194403. "hide_name": 0,
  194404. "bits": [ 704, 5496, 645 ],
  194405. "attributes": {
  194406. "force_downto": "00000000000000000000000000000001",
  194407. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194408. }
  194409. },
  194410. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_2_I3": {
  194411. "hide_name": 0,
  194412. "bits": [ 5411, 704, 5498 ],
  194413. "attributes": {
  194414. "force_downto": "00000000000000000000000000000001",
  194415. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194416. }
  194417. },
  194418. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_3_I3": {
  194419. "hide_name": 0,
  194420. "bits": [ 5413, 704, 5500 ],
  194421. "attributes": {
  194422. "force_downto": "00000000000000000000000000000001",
  194423. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194424. }
  194425. },
  194426. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_4_I3": {
  194427. "hide_name": 0,
  194428. "bits": [ 5389, 704, 5502 ],
  194429. "attributes": {
  194430. "force_downto": "00000000000000000000000000000001",
  194431. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194432. }
  194433. },
  194434. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_5_I3": {
  194435. "hide_name": 0,
  194436. "bits": [ 5423, 704, 5504 ],
  194437. "attributes": {
  194438. "force_downto": "00000000000000000000000000000001",
  194439. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194440. }
  194441. },
  194442. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_6_I2": {
  194443. "hide_name": 0,
  194444. "bits": [ 704, 5506, 645 ],
  194445. "attributes": {
  194446. "force_downto": "00000000000000000000000000000001",
  194447. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194448. }
  194449. },
  194450. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_7_I2": {
  194451. "hide_name": 0,
  194452. "bits": [ 704, 5508, 5386 ],
  194453. "attributes": {
  194454. "force_downto": "00000000000000000000000000000001",
  194455. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194456. }
  194457. },
  194458. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_8_I3": {
  194459. "hide_name": 0,
  194460. "bits": [ 704, 133, 5510 ],
  194461. "attributes": {
  194462. "force_downto": "00000000000000000000000000000001",
  194463. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194464. }
  194465. },
  194466. "memctrl_I.rf_overflow_SB_LUT4_I1_O_SB_LUT4_O_I2": {
  194467. "hide_name": 0,
  194468. "bits": [ 704, 5494, 5386 ],
  194469. "attributes": {
  194470. "force_downto": "00000000000000000000000000000001",
  194471. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194472. }
  194473. },
  194474. "memctrl_I.rf_overflow_clr": {
  194475. "hide_name": 0,
  194476. "bits": [ 5513 ],
  194477. "attributes": {
  194478. "hdlname": "memctrl_I rf_overflow_clr",
  194479. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:237.14-237.29"
  194480. }
  194481. },
  194482. "memctrl_I.rf_overflow_clr_SB_DFF_Q_D": {
  194483. "hide_name": 0,
  194484. "bits": [ 5512 ],
  194485. "attributes": {
  194486. }
  194487. },
  194488. "memctrl_I.rf_rden_arm": {
  194489. "hide_name": 0,
  194490. "bits": [ 5515 ],
  194491. "attributes": {
  194492. "hdlname": "memctrl_I rf_rden_arm",
  194493. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:238.14-238.25"
  194494. }
  194495. },
  194496. "memctrl_I.rf_rden_arm_SB_DFF_Q_D": {
  194497. "hide_name": 0,
  194498. "bits": [ 5514 ],
  194499. "attributes": {
  194500. }
  194501. },
  194502. "memctrl_I.rf_rden_arm_SB_LUT4_I3_O": {
  194503. "hide_name": 0,
  194504. "bits": [ 643 ],
  194505. "attributes": {
  194506. }
  194507. },
  194508. "memctrl_I.rom_cmd_len.i": {
  194509. "hide_name": 0,
  194510. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  194511. "signed": 1,
  194512. "attributes": {
  194513. "hdlname": "memctrl_I rom_cmd_len.i",
  194514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:532.11-532.12"
  194515. }
  194516. },
  194517. "memctrl_I.rst": {
  194518. "hide_name": 0,
  194519. "bits": [ 127 ],
  194520. "attributes": {
  194521. "hdlname": "memctrl_I rst",
  194522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:73.13-73.16"
  194523. }
  194524. },
  194525. "memctrl_I.shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.chan": {
  194526. "hide_name": 0,
  194527. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194528. "signed": 1,
  194529. "attributes": {
  194530. "hdlname": "memctrl_I shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.chan",
  194531. "nosync": "00000000000000000000000000000001",
  194532. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:131.11-131.15"
  194533. }
  194534. },
  194535. "memctrl_I.shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.io": {
  194536. "hide_name": 0,
  194537. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194538. "signed": 1,
  194539. "attributes": {
  194540. "hdlname": "memctrl_I shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.io",
  194541. "nosync": "00000000000000000000000000000001",
  194542. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:131.17-131.19"
  194543. }
  194544. },
  194545. "memctrl_I.shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.shift": {
  194546. "hide_name": 0,
  194547. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194548. "attributes": {
  194549. "hdlname": "memctrl_I shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.shift",
  194550. "nosync": "00000000000000000000000000000001",
  194551. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:130.19-130.24"
  194552. }
  194553. },
  194554. "memctrl_I.shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.t": {
  194555. "hide_name": 0,
  194556. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194557. "signed": 1,
  194558. "attributes": {
  194559. "hdlname": "memctrl_I shift2phy_qpi_cmd$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:743$2983.t",
  194560. "nosync": "00000000000000000000000000000001",
  194561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:131.21-131.22"
  194562. }
  194563. },
  194564. "memctrl_I.shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.chan": {
  194565. "hide_name": 0,
  194566. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194567. "signed": 1,
  194568. "attributes": {
  194569. "hdlname": "memctrl_I shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.chan",
  194570. "nosync": "00000000000000000000000000000001",
  194571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:152.11-152.15"
  194572. }
  194573. },
  194574. "memctrl_I.shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.io": {
  194575. "hide_name": 0,
  194576. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194577. "signed": 1,
  194578. "attributes": {
  194579. "hdlname": "memctrl_I shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.io",
  194580. "nosync": "00000000000000000000000000000001",
  194581. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:152.17-152.19"
  194582. }
  194583. },
  194584. "memctrl_I.shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.shift": {
  194585. "hide_name": 0,
  194586. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194587. "attributes": {
  194588. "hdlname": "memctrl_I shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.shift",
  194589. "nosync": "00000000000000000000000000000001",
  194590. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:151.19-151.24"
  194591. }
  194592. },
  194593. "memctrl_I.shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.t": {
  194594. "hide_name": 0,
  194595. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194596. "signed": 1,
  194597. "attributes": {
  194598. "hdlname": "memctrl_I shift2phy_qpi_data$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:745$2984.t",
  194599. "nosync": "00000000000000000000000000000001",
  194600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:152.21-152.22"
  194601. }
  194602. },
  194603. "memctrl_I.shift2phy_spi$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:748$2985.base": {
  194604. "hide_name": 0,
  194605. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194606. "attributes": {
  194607. "hdlname": "memctrl_I shift2phy_spi$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:748$2985.base",
  194608. "nosync": "00000000000000000000000000000001",
  194609. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:108.19-108.23"
  194610. }
  194611. },
  194612. "memctrl_I.shift2phy_spi$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:748$2985.chan": {
  194613. "hide_name": 0,
  194614. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194615. "signed": 1,
  194616. "attributes": {
  194617. "hdlname": "memctrl_I shift2phy_spi$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:748$2985.chan",
  194618. "nosync": "00000000000000000000000000000001",
  194619. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:109.11-109.15"
  194620. }
  194621. },
  194622. "memctrl_I.shift2phy_spi$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:748$2985.shift": {
  194623. "hide_name": 0,
  194624. "bits": [ "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x", "x" ],
  194625. "attributes": {
  194626. "hdlname": "memctrl_I shift2phy_spi$func$/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:748$2985.shift",
  194627. "nosync": "00000000000000000000000000000001",
  194628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:107.19-107.24"
  194629. }
  194630. },
  194631. "memctrl_I.si_data_n": {
  194632. "hide_name": 0,
  194633. "bits": [ 218, 217, 216, 225, 273, 272, 271, 280, 222, 221, 220, 219, 277, 276, 275, 274, 211, 210, 224, 223, 266, 265, 279, 278, 215, 214, 213, 212, 270, 269, 268, 267 ],
  194634. "attributes": {
  194635. "hdlname": "memctrl_I si_data_n",
  194636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:307.14-307.23"
  194637. }
  194638. },
  194639. "memctrl_I.si_dst_1": {
  194640. "hide_name": 0,
  194641. "bits": [ 5399, 5397 ],
  194642. "attributes": {
  194643. "hdlname": "memctrl_I si_dst_1",
  194644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:304.14-304.22"
  194645. }
  194646. },
  194647. "memctrl_I.si_dst_1_SB_DFFSR_Q_1_D": {
  194648. "hide_name": 0,
  194649. "bits": [ 5550 ],
  194650. "attributes": {
  194651. }
  194652. },
  194653. "memctrl_I.si_dst_1_SB_DFFSR_Q_R": {
  194654. "hide_name": 0,
  194655. "bits": [ 5549 ],
  194656. "attributes": {
  194657. }
  194658. },
  194659. "memctrl_I.si_dst_n": {
  194660. "hide_name": 0,
  194661. "bits": [ 641, 230 ],
  194662. "attributes": {
  194663. "hdlname": "memctrl_I si_dst_n",
  194664. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:305.14-305.22"
  194665. }
  194666. },
  194667. "memctrl_I.si_mode_0": {
  194668. "hide_name": 0,
  194669. "bits": [ 5404 ],
  194670. "attributes": {
  194671. "hdlname": "memctrl_I si_mode_0",
  194672. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:302.14-302.23"
  194673. }
  194674. },
  194675. "memctrl_I.si_mode_nm1": {
  194676. "hide_name": 0,
  194677. "bits": [ 5409 ],
  194678. "attributes": {
  194679. "hdlname": "memctrl_I si_mode_nm1",
  194680. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:303.14-303.25"
  194681. }
  194682. },
  194683. "memctrl_I.so_cnt": {
  194684. "hide_name": 0,
  194685. "bits": [ "1", 5560, 5554, 5556, 5558, 5553 ],
  194686. "attributes": {
  194687. "hdlname": "memctrl_I so_cnt",
  194688. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:297.14-297.20"
  194689. }
  194690. },
  194691. "memctrl_I.so_cnt_SB_CARRY_CI_CO": {
  194692. "hide_name": 0,
  194693. "bits": [ 5555 ],
  194694. "attributes": {
  194695. "abc9_carry": "00000000000000000000000000000001",
  194696. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  194697. }
  194698. },
  194699. "memctrl_I.so_cnt_SB_CARRY_I0_CO": {
  194700. "hide_name": 0,
  194701. "bits": [ 5557 ],
  194702. "attributes": {
  194703. "abc9_carry": "00000000000000000000000000000001",
  194704. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  194705. }
  194706. },
  194707. "memctrl_I.so_cnt_SB_DFF_Q_D": {
  194708. "hide_name": 0,
  194709. "bits": [ 5563, 5562, 5561, 5611 ],
  194710. "offset": 2,
  194711. "attributes": {
  194712. }
  194713. },
  194714. "memctrl_I.so_cnt_SB_LUT4_I1_1_O": {
  194715. "hide_name": 0,
  194716. "bits": [ 5566, 5424, 5567 ],
  194717. "attributes": {
  194718. "force_downto": "00000000000000000000000000000001",
  194719. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194720. }
  194721. },
  194722. "memctrl_I.so_cnt_SB_LUT4_I1_O": {
  194723. "hide_name": 0,
  194724. "bits": [ 5564, 5424, 5565 ],
  194725. "attributes": {
  194726. "force_downto": "00000000000000000000000000000001",
  194727. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194728. }
  194729. },
  194730. "memctrl_I.so_data": {
  194731. "hide_name": 0,
  194732. "bits": [ 5592, 5590, 5588, 5586, 5584, 5582, 5580, 5578, 5576, 5574, 5608, 5606, 5604, 5602, 5600, 5598, 5596, 5729, 5790, 5910, 5594, 5736, 5798, 5913, 5572, 5747, 5804, 5919, 5570, 5685, 5688, 5691 ],
  194733. "attributes": {
  194734. "hdlname": "memctrl_I so_data",
  194735. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:299.14-299.21"
  194736. }
  194737. },
  194738. "memctrl_I.so_dst": {
  194739. "hide_name": 0,
  194740. "bits": [ 5548, 5552 ],
  194741. "attributes": {
  194742. "hdlname": "memctrl_I so_dst",
  194743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:296.14-296.20"
  194744. }
  194745. },
  194746. "memctrl_I.so_last": {
  194747. "hide_name": 0,
  194748. "bits": [ 5553 ],
  194749. "attributes": {
  194750. "hdlname": "memctrl_I so_last",
  194751. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:298.14-298.21"
  194752. }
  194753. },
  194754. "memctrl_I.so_ld_cnt": {
  194755. "hide_name": 0,
  194756. "bits": [ "1", 5559, 7235, 7236, 7237, 7235 ],
  194757. "attributes": {
  194758. "hdlname": "memctrl_I so_ld_cnt",
  194759. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:291.14-291.23",
  194760. "unused_bits": "2 3 4 5"
  194761. }
  194762. },
  194763. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2": {
  194764. "hide_name": 0,
  194765. "bits": [ 5393, 5615 ],
  194766. "attributes": {
  194767. "force_downto": "00000000000000000000000000000001",
  194768. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194769. }
  194770. },
  194771. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_1_O": {
  194772. "hide_name": 0,
  194773. "bits": [ 5395, 5617, 5609 ],
  194774. "attributes": {
  194775. "force_downto": "00000000000000000000000000000001",
  194776. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194777. }
  194778. },
  194779. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_1_O_SB_LUT4_I3_O": {
  194780. "hide_name": 0,
  194781. "bits": [ 5619, 5616, 5618 ],
  194782. "attributes": {
  194783. "force_downto": "00000000000000000000000000000001",
  194784. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194785. }
  194786. },
  194787. "memctrl_I.so_ld_cnt_SB_LUT4_O_I2_SB_LUT4_I3_O": {
  194788. "hide_name": 0,
  194789. "bits": [ 649 ],
  194790. "attributes": {
  194791. }
  194792. },
  194793. "memctrl_I.so_ld_dst": {
  194794. "hide_name": 0,
  194795. "bits": [ "x", 5610 ],
  194796. "attributes": {
  194797. "hdlname": "memctrl_I so_ld_dst",
  194798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:290.14-290.23"
  194799. }
  194800. },
  194801. "memctrl_I.so_ld_now": {
  194802. "hide_name": 0,
  194803. "bits": [ 5390 ],
  194804. "attributes": {
  194805. "hdlname": "memctrl_I so_ld_now",
  194806. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:287.14-287.23"
  194807. }
  194808. },
  194809. "memctrl_I.so_mode": {
  194810. "hide_name": 0,
  194811. "bits": [ 5404, 5551 ],
  194812. "attributes": {
  194813. "hdlname": "memctrl_I so_mode",
  194814. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:295.14-295.21"
  194815. }
  194816. },
  194817. "memctrl_I.so_mode_SB_DFFESS_Q_D": {
  194818. "hide_name": 0,
  194819. "bits": [ 5403, 5620 ],
  194820. "attributes": {
  194821. "force_downto": "00000000000000000000000000000001",
  194822. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:553.3-595.10|/usr/bin/../share/yosys/techmap.v:578.19-578.22"
  194823. }
  194824. },
  194825. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3": {
  194826. "hide_name": 0,
  194827. "bits": [ 5389, 5393, 5395, 5621 ],
  194828. "attributes": {
  194829. "force_downto": "00000000000000000000000000000001",
  194830. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194831. }
  194832. },
  194833. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2_O": {
  194834. "hide_name": 0,
  194835. "bits": [ 5393, 5614, 5615, 5616 ],
  194836. "attributes": {
  194837. "force_downto": "00000000000000000000000000000001",
  194838. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194839. }
  194840. },
  194841. "memctrl_I.so_mode_SB_DFFESS_Q_D_SB_LUT4_O_1_I3_SB_LUT4_I2_O_SB_LUT4_I2_1_O": {
  194842. "hide_name": 0,
  194843. "bits": [ 5424, 5553, 5568, 5557 ],
  194844. "attributes": {
  194845. "force_downto": "00000000000000000000000000000001",
  194846. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:695.14-695.32|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194847. }
  194848. },
  194849. "memctrl_I.so_mode_SB_DFFESS_Q_S": {
  194850. "hide_name": 0,
  194851. "bits": [ 5405 ],
  194852. "attributes": {
  194853. }
  194854. },
  194855. "memctrl_I.so_mode_SB_LUT4_I2_O": {
  194856. "hide_name": 0,
  194857. "bits": [ 5584, 5622, 5624, 5623 ],
  194858. "attributes": {
  194859. "force_downto": "00000000000000000000000000000001",
  194860. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194861. }
  194862. },
  194863. "memctrl_I.so_valid": {
  194864. "hide_name": 0,
  194865. "bits": [ 5461 ],
  194866. "attributes": {
  194867. "hdlname": "memctrl_I so_valid",
  194868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:294.14-294.22"
  194869. }
  194870. },
  194871. "memctrl_I.so_valid_SB_DFFSR_Q_D": {
  194872. "hide_name": 0,
  194873. "bits": [ 5625 ],
  194874. "attributes": {
  194875. }
  194876. },
  194877. "memctrl_I.so_valid_SB_DFFSR_Q_D_SB_LUT4_O_I2": {
  194878. "hide_name": 0,
  194879. "bits": [ 133, 5465, 5417 ],
  194880. "attributes": {
  194881. "force_downto": "00000000000000000000000000000001",
  194882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194883. }
  194884. },
  194885. "memctrl_I.state": {
  194886. "hide_name": 0,
  194887. "bits": [ 133, 5395, 5394, 5451, 5389, 5462, 5393 ],
  194888. "attributes": {
  194889. "onehot": "00000000000000000000000000000001"
  194890. }
  194891. },
  194892. "memctrl_I.wb_ack": {
  194893. "hide_name": 0,
  194894. "bits": [ 5415 ],
  194895. "attributes": {
  194896. "hdlname": "memctrl_I wb_ack",
  194897. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:69.21-69.27"
  194898. }
  194899. },
  194900. "memctrl_I.wb_ack_SB_DFFSR_Q_D": {
  194901. "hide_name": 0,
  194902. "bits": [ 5626 ],
  194903. "attributes": {
  194904. }
  194905. },
  194906. "memctrl_I.wb_ack_SB_DFFSR_Q_R": {
  194907. "hide_name": 0,
  194908. "bits": [ 5627 ],
  194909. "attributes": {
  194910. }
  194911. },
  194912. "memctrl_I.wb_ack_SB_DFFSR_Q_R_SB_LUT4_O_I3": {
  194913. "hide_name": 0,
  194914. "bits": [ 5386, 5387, 5628 ],
  194915. "attributes": {
  194916. "force_downto": "00000000000000000000000000000001",
  194917. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194918. }
  194919. },
  194920. "memctrl_I.wb_ack_SB_DFFSR_Q_R_SB_LUT4_O_I3_SB_LUT4_O_I3": {
  194921. "hide_name": 0,
  194922. "bits": [ 697, 699, 645, 5629 ],
  194923. "attributes": {
  194924. "force_downto": "00000000000000000000000000000001",
  194925. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194926. }
  194927. },
  194928. "memctrl_I.wb_addr": {
  194929. "hide_name": 0,
  194930. "bits": [ 706, 704, 701, 699, 697 ],
  194931. "attributes": {
  194932. "hdlname": "memctrl_I wb_addr",
  194933. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:64.21-64.28"
  194934. }
  194935. },
  194936. "memctrl_I.wb_cyc": {
  194937. "hide_name": 0,
  194938. "bits": [ 5631 ],
  194939. "attributes": {
  194940. "hdlname": "memctrl_I wb_cyc",
  194941. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:68.21-68.27"
  194942. }
  194943. },
  194944. "memctrl_I.wb_cyc_SB_DFFSR_Q_D": {
  194945. "hide_name": 0,
  194946. "bits": [ 5630 ],
  194947. "attributes": {
  194948. }
  194949. },
  194950. "memctrl_I.wb_cyc_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  194951. "hide_name": 0,
  194952. "bits": [ 689, 5632 ],
  194953. "attributes": {
  194954. "force_downto": "00000000000000000000000000000001",
  194955. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194956. }
  194957. },
  194958. "memctrl_I.wb_cyc_SB_LUT4_I3_O": {
  194959. "hide_name": 0,
  194960. "bits": [ 689, 687, 5388, 5632 ],
  194961. "attributes": {
  194962. "force_downto": "00000000000000000000000000000001",
  194963. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  194964. }
  194965. },
  194966. "memctrl_I.wb_cyc_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  194967. "hide_name": 0,
  194968. "bits": [ 5633 ],
  194969. "attributes": {
  194970. }
  194971. },
  194972. "memctrl_I.wb_rdata": {
  194973. "hide_name": 0,
  194974. "bits": [ 5659, 5658, 5656, 5648, 5655, 5654, 5647, 5645, 5644, 5643, 5653, 5652, 5642, 5651, 5650, 5649, 5641, 5640, 5639, 5638, 5637, 5636, 5665, 5664, 5663, 5662, 5661, 5660, 5657, 5646, 5635, 5634 ],
  194975. "attributes": {
  194976. "hdlname": "memctrl_I wb_rdata",
  194977. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:66.21-66.29"
  194978. }
  194979. },
  194980. "memctrl_I.wb_wdata": {
  194981. "hide_name": 0,
  194982. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  194983. "attributes": {
  194984. "hdlname": "memctrl_I wb_wdata",
  194985. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:65.21-65.29"
  194986. }
  194987. },
  194988. "memctrl_I.wb_we": {
  194989. "hide_name": 0,
  194990. "bits": [ 469 ],
  194991. "attributes": {
  194992. "hdlname": "memctrl_I wb_we",
  194993. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:67.21-67.26"
  194994. }
  194995. },
  194996. "memctrl_I.wbi_rd_csr": {
  194997. "hide_name": 0,
  194998. "bits": [ 133, 5423, 5389, "0", 5413, 5411, "0", "0", "0", "0", 7238, 7239, "0", 5491, 7240, 7241, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  194999. "attributes": {
  195000. "hdlname": "memctrl_I wbi_rd_csr",
  195001. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:214.14-214.24",
  195002. "unused_bits": "10 11 14 15"
  195003. }
  195004. },
  195005. "memctrl_I.wbi_rd_rf": {
  195006. "hide_name": 0,
  195007. "bits": [ 7215, 7216, 7217, 5440, 7218, 7219, 5439, 5437, 5436, 5435, 7220, 7221, 5434, 7222, 7223, 7224, 5433, 5432, 5431, 5430, 5429, 5428, 5447, 5446, 5445, 5444, 5443, 5442, 5441, 5438, 5427, 5426 ],
  195008. "attributes": {
  195009. "hdlname": "memctrl_I wbi_rd_rf",
  195010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:215.14-215.23",
  195011. "unused_bits": "0 1 2 4 5 10 11 13 14 15"
  195012. }
  195013. },
  195014. "memctrl_I.xfer_cnt": {
  195015. "hide_name": 0,
  195016. "bits": [ 654, 653, 656, 659, 662, 665, 652, 120 ],
  195017. "attributes": {
  195018. "hdlname": "memctrl_I xfer_cnt",
  195019. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:260.14-260.22"
  195020. }
  195021. },
  195022. "memctrl_I.xfer_last": {
  195023. "hide_name": 0,
  195024. "bits": [ 120 ],
  195025. "attributes": {
  195026. "hdlname": "memctrl_I xfer_last",
  195027. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:261.14-261.23"
  195028. }
  195029. },
  195030. "mi_addr": {
  195031. "hide_name": 0,
  195032. "bits": [ "0", "0", "0", 152, 153, 154, 155, 156, 157, 158, 159, 160, 6923, 6924, 6925, 6926, 6927, 6928, 6929, 6930, 6931, 6932, 6933, 6934 ],
  195033. "attributes": {
  195034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:105.14-105.21",
  195035. "unused_bits": "12 13 14 15 16 17 18 19 20 21 22 23"
  195036. }
  195037. },
  195038. "mi_len": {
  195039. "hide_name": 0,
  195040. "bits": [ "1", "1", "1", "0", "0", "0", "0" ],
  195041. "attributes": {
  195042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:106.14-106.20"
  195043. }
  195044. },
  195045. "mi_rdata": {
  195046. "hide_name": 0,
  195047. "bits": [ 215, 214, 213, 212, 270, 269, 268, 267, 211, 210, 224, 223, 266, 265, 279, 278, 222, 221, 220, 219, 277, 276, 275, 274, 218, 217, 216, 225, 273, 272, 271, 280 ],
  195048. "attributes": {
  195049. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:117.14-117.22"
  195050. }
  195051. },
  195052. "mi_ready": {
  195053. "hide_name": 0,
  195054. "bits": [ 133 ],
  195055. "attributes": {
  195056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:110.14-110.22"
  195057. }
  195058. },
  195059. "mi_rlast": {
  195060. "hide_name": 0,
  195061. "bits": [ 641 ],
  195062. "attributes": {
  195063. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:119.14-119.22"
  195064. }
  195065. },
  195066. "mi_rstb": {
  195067. "hide_name": 0,
  195068. "bits": [ 230 ],
  195069. "attributes": {
  195070. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:118.14-118.21"
  195071. }
  195072. },
  195073. "mi_wdata": {
  195074. "hide_name": 0,
  195075. "bits": [ 180, 181, 182, 183, 249, 250, 251, 252, 184, 185, 186, 187, 253, 254, 255, 256, 188, 189, 190, 191, 257, 258, 259, 260, 192, 193, 194, 195, 261, 262, 263, 264 ],
  195076. "attributes": {
  195077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:112.14-112.22"
  195078. }
  195079. },
  195080. "mi_wlast": {
  195081. "hide_name": 0,
  195082. "bits": [ 120 ],
  195083. "attributes": {
  195084. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:115.14-115.22"
  195085. }
  195086. },
  195087. "phy_I.bit[0].isd_I.clk_1x": {
  195088. "hide_name": 0,
  195089. "bits": [ 42 ],
  195090. "attributes": {
  195091. "hdlname": "phy_I bit[0].isd_I clk_1x",
  195092. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:23.20-23.26"
  195093. }
  195094. },
  195095. "phy_I.bit[0].isd_I.clk_4x": {
  195096. "hide_name": 0,
  195097. "bits": [ 5666 ],
  195098. "attributes": {
  195099. "hdlname": "phy_I bit[0].isd_I clk_4x",
  195100. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:24.20-24.26"
  195101. }
  195102. },
  195103. "phy_I.bit[0].isd_I.d": {
  195104. "hide_name": 0,
  195105. "bits": [ 5667, "0" ],
  195106. "attributes": {
  195107. "hdlname": "phy_I bit[0].isd_I d",
  195108. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:18.20-18.21"
  195109. }
  195110. },
  195111. "phy_I.bit[0].isd_I.edge_sel": {
  195112. "hide_name": 0,
  195113. "bits": [ "0" ],
  195114. "attributes": {
  195115. "hdlname": "phy_I bit[0].isd_I edge_sel",
  195116. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:20.20-20.28"
  195117. }
  195118. },
  195119. "phy_I.bit[0].isd_I.fcap_in[0]": {
  195120. "hide_name": 0,
  195121. "bits": [ 5668, 5669, 5670, 5671 ],
  195122. "attributes": {
  195123. "hdlname": "phy_I bit[0].isd_I fcap_in[0]",
  195124. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:46.13-46.20"
  195125. }
  195126. },
  195127. "phy_I.bit[0].isd_I.fcap_out[0]": {
  195128. "hide_name": 0,
  195129. "bits": [ 5673, 5674, 5675, 5676 ],
  195130. "attributes": {
  195131. "hdlname": "phy_I bit[0].isd_I fcap_out[0]",
  195132. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  195133. }
  195134. },
  195135. "phy_I.bit[0].isd_I.fcap_out[1]": {
  195136. "hide_name": 0,
  195137. "bits": [ "0", "0", "0", "0" ],
  195138. "attributes": {
  195139. "hdlname": "phy_I bit[0].isd_I fcap_out[1]",
  195140. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  195141. }
  195142. },
  195143. "phy_I.bit[0].isd_I.genblk1[0].fp.din": {
  195144. "hide_name": 0,
  195145. "bits": [ 5667 ],
  195146. "attributes": {
  195147. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.din",
  195148. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:66.10-66.13"
  195149. }
  195150. },
  195151. "phy_I.bit[0].isd_I.genblk1[0].fp.edge_active": {
  195152. "hide_name": 0,
  195153. "bits": [ "1" ],
  195154. "attributes": {
  195155. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.edge_active",
  195156. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:64.10-64.21"
  195157. }
  195158. },
  195159. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.c": {
  195160. "hide_name": 0,
  195161. "bits": [ 5666 ],
  195162. "attributes": {
  195163. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[0].dff_shift_I c",
  195164. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195165. }
  195166. },
  195167. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.d": {
  195168. "hide_name": 0,
  195169. "bits": [ 5667 ],
  195170. "attributes": {
  195171. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[0].dff_shift_I d",
  195172. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195173. }
  195174. },
  195175. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.q": {
  195176. "hide_name": 0,
  195177. "bits": [ 5668 ],
  195178. "attributes": {
  195179. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[0].dff_shift_I q",
  195180. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195181. }
  195182. },
  195183. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.c": {
  195184. "hide_name": 0,
  195185. "bits": [ 5666 ],
  195186. "attributes": {
  195187. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[1].dff_shift_I c",
  195188. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195189. }
  195190. },
  195191. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.d": {
  195192. "hide_name": 0,
  195193. "bits": [ 5668 ],
  195194. "attributes": {
  195195. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[1].dff_shift_I d",
  195196. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195197. }
  195198. },
  195199. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.q": {
  195200. "hide_name": 0,
  195201. "bits": [ 5669 ],
  195202. "attributes": {
  195203. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[1].dff_shift_I q",
  195204. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195205. }
  195206. },
  195207. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.c": {
  195208. "hide_name": 0,
  195209. "bits": [ 5666 ],
  195210. "attributes": {
  195211. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[2].dff_shift_I c",
  195212. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195213. }
  195214. },
  195215. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.d": {
  195216. "hide_name": 0,
  195217. "bits": [ 5669 ],
  195218. "attributes": {
  195219. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[2].dff_shift_I d",
  195220. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195221. }
  195222. },
  195223. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.q": {
  195224. "hide_name": 0,
  195225. "bits": [ 5670 ],
  195226. "attributes": {
  195227. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[2].dff_shift_I q",
  195228. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195229. }
  195230. },
  195231. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.c": {
  195232. "hide_name": 0,
  195233. "bits": [ 5666 ],
  195234. "attributes": {
  195235. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[3].dff_shift_I c",
  195236. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195237. }
  195238. },
  195239. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.d": {
  195240. "hide_name": 0,
  195241. "bits": [ 5670 ],
  195242. "attributes": {
  195243. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[3].dff_shift_I d",
  195244. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195245. }
  195246. },
  195247. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.q": {
  195248. "hide_name": 0,
  195249. "bits": [ 5671 ],
  195250. "attributes": {
  195251. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk2[3].dff_shift_I q",
  195252. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195253. }
  195254. },
  195255. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.c": {
  195256. "hide_name": 0,
  195257. "bits": [ 5666 ],
  195258. "attributes": {
  195259. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[0].dff_shift_I c",
  195260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195261. }
  195262. },
  195263. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.d": {
  195264. "hide_name": 0,
  195265. "bits": [ 5668 ],
  195266. "attributes": {
  195267. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[0].dff_shift_I d",
  195268. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195269. }
  195270. },
  195271. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.e": {
  195272. "hide_name": 0,
  195273. "bits": [ 5672 ],
  195274. "attributes": {
  195275. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[0].dff_shift_I e",
  195276. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  195277. }
  195278. },
  195279. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.q": {
  195280. "hide_name": 0,
  195281. "bits": [ 5673 ],
  195282. "attributes": {
  195283. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[0].dff_shift_I q",
  195284. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195285. }
  195286. },
  195287. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.c": {
  195288. "hide_name": 0,
  195289. "bits": [ 5666 ],
  195290. "attributes": {
  195291. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[1].dff_shift_I c",
  195292. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195293. }
  195294. },
  195295. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.d": {
  195296. "hide_name": 0,
  195297. "bits": [ 5669 ],
  195298. "attributes": {
  195299. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[1].dff_shift_I d",
  195300. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195301. }
  195302. },
  195303. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.e": {
  195304. "hide_name": 0,
  195305. "bits": [ 5672 ],
  195306. "attributes": {
  195307. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[1].dff_shift_I e",
  195308. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  195309. }
  195310. },
  195311. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.q": {
  195312. "hide_name": 0,
  195313. "bits": [ 5674 ],
  195314. "attributes": {
  195315. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[1].dff_shift_I q",
  195316. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195317. }
  195318. },
  195319. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.c": {
  195320. "hide_name": 0,
  195321. "bits": [ 5666 ],
  195322. "attributes": {
  195323. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[2].dff_shift_I c",
  195324. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195325. }
  195326. },
  195327. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.d": {
  195328. "hide_name": 0,
  195329. "bits": [ 5670 ],
  195330. "attributes": {
  195331. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[2].dff_shift_I d",
  195332. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195333. }
  195334. },
  195335. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.e": {
  195336. "hide_name": 0,
  195337. "bits": [ 5672 ],
  195338. "attributes": {
  195339. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[2].dff_shift_I e",
  195340. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  195341. }
  195342. },
  195343. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.q": {
  195344. "hide_name": 0,
  195345. "bits": [ 5675 ],
  195346. "attributes": {
  195347. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[2].dff_shift_I q",
  195348. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195349. }
  195350. },
  195351. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.c": {
  195352. "hide_name": 0,
  195353. "bits": [ 5666 ],
  195354. "attributes": {
  195355. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[3].dff_shift_I c",
  195356. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195357. }
  195358. },
  195359. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.d": {
  195360. "hide_name": 0,
  195361. "bits": [ 5671 ],
  195362. "attributes": {
  195363. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[3].dff_shift_I d",
  195364. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195365. }
  195366. },
  195367. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.e": {
  195368. "hide_name": 0,
  195369. "bits": [ 5672 ],
  195370. "attributes": {
  195371. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[3].dff_shift_I e",
  195372. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  195373. }
  195374. },
  195375. "phy_I.bit[0].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.q": {
  195376. "hide_name": 0,
  195377. "bits": [ 5676 ],
  195378. "attributes": {
  195379. "hdlname": "phy_I bit[0].isd_I genblk1[0].fp.genblk4[3].dff_shift_I q",
  195380. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195381. }
  195382. },
  195383. "phy_I.bit[0].isd_I.genblk2.genblk2[0].dff_scap_I.c": {
  195384. "hide_name": 0,
  195385. "bits": [ 42 ],
  195386. "attributes": {
  195387. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[0].dff_scap_I c",
  195388. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195389. }
  195390. },
  195391. "phy_I.bit[0].isd_I.genblk2.genblk2[0].dff_scap_I.d": {
  195392. "hide_name": 0,
  195393. "bits": [ 5673 ],
  195394. "attributes": {
  195395. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[0].dff_scap_I d",
  195396. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195397. }
  195398. },
  195399. "phy_I.bit[0].isd_I.genblk2.genblk2[0].dff_scap_I.q": {
  195400. "hide_name": 0,
  195401. "bits": [ 5677 ],
  195402. "attributes": {
  195403. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[0].dff_scap_I q",
  195404. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195405. }
  195406. },
  195407. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.c": {
  195408. "hide_name": 0,
  195409. "bits": [ 42 ],
  195410. "attributes": {
  195411. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[1].dff_scap_I c",
  195412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195413. }
  195414. },
  195415. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.d": {
  195416. "hide_name": 0,
  195417. "bits": [ 5674 ],
  195418. "attributes": {
  195419. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[1].dff_scap_I d",
  195420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195421. }
  195422. },
  195423. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q": {
  195424. "hide_name": 0,
  195425. "bits": [ 5678 ],
  195426. "attributes": {
  195427. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[1].dff_scap_I q",
  195428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195429. }
  195430. },
  195431. "phy_I.bit[0].isd_I.genblk2.genblk2[1].dff_scap_I.q_SB_LUT4_I2_O": {
  195432. "hide_name": 0,
  195433. "bits": [ 5541, 5540, 5538, 5537, 5536, 5535, 5534, 5533, 5532, 5531, 5530, 5529, 5527, 5526, 5525, 5524, 5523, 5522, 5521, 5520, 5519, 5518, 5547, 5546, 5545, 5544, 5543, 5542, 5539, 5528, 5517, 5516 ],
  195434. "attributes": {
  195435. }
  195436. },
  195437. "phy_I.bit[0].isd_I.genblk2.genblk2[2].dff_scap_I.c": {
  195438. "hide_name": 0,
  195439. "bits": [ 42 ],
  195440. "attributes": {
  195441. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[2].dff_scap_I c",
  195442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195443. }
  195444. },
  195445. "phy_I.bit[0].isd_I.genblk2.genblk2[2].dff_scap_I.d": {
  195446. "hide_name": 0,
  195447. "bits": [ 5675 ],
  195448. "attributes": {
  195449. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[2].dff_scap_I d",
  195450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195451. }
  195452. },
  195453. "phy_I.bit[0].isd_I.genblk2.genblk2[2].dff_scap_I.q": {
  195454. "hide_name": 0,
  195455. "bits": [ 5680 ],
  195456. "attributes": {
  195457. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[2].dff_scap_I q",
  195458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195459. }
  195460. },
  195461. "phy_I.bit[0].isd_I.genblk2.genblk2[3].dff_scap_I.c": {
  195462. "hide_name": 0,
  195463. "bits": [ 42 ],
  195464. "attributes": {
  195465. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[3].dff_scap_I c",
  195466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195467. }
  195468. },
  195469. "phy_I.bit[0].isd_I.genblk2.genblk2[3].dff_scap_I.d": {
  195470. "hide_name": 0,
  195471. "bits": [ 5676 ],
  195472. "attributes": {
  195473. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[3].dff_scap_I d",
  195474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195475. }
  195476. },
  195477. "phy_I.bit[0].isd_I.genblk2.genblk2[3].dff_scap_I.q": {
  195478. "hide_name": 0,
  195479. "bits": [ 5681 ],
  195480. "attributes": {
  195481. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[3].dff_scap_I q",
  195482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195483. }
  195484. },
  195485. "phy_I.bit[0].isd_I.genblk2.genblk2[4].dff_scap_I.c": {
  195486. "hide_name": 0,
  195487. "bits": [ 42 ],
  195488. "attributes": {
  195489. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[4].dff_scap_I c",
  195490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195491. }
  195492. },
  195493. "phy_I.bit[0].isd_I.genblk2.genblk2[4].dff_scap_I.d": {
  195494. "hide_name": 0,
  195495. "bits": [ 5677 ],
  195496. "attributes": {
  195497. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[4].dff_scap_I d",
  195498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195499. }
  195500. },
  195501. "phy_I.bit[0].isd_I.genblk2.genblk2[4].dff_scap_I.q": {
  195502. "hide_name": 0,
  195503. "bits": [ 5682 ],
  195504. "attributes": {
  195505. "hdlname": "phy_I bit[0].isd_I genblk2.genblk2[4].dff_scap_I q",
  195506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195507. }
  195508. },
  195509. "phy_I.bit[0].isd_I.genblk2.scap_in": {
  195510. "hide_name": 0,
  195511. "bits": [ 5673, 5674, 5675, 5676, 5677 ],
  195512. "attributes": {
  195513. "hdlname": "phy_I bit[0].isd_I genblk2.scap_in",
  195514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:168.21-168.28"
  195515. }
  195516. },
  195517. "phy_I.bit[0].isd_I.genblk2.scap_out": {
  195518. "hide_name": 0,
  195519. "bits": [ 5677, 5678, 5680, 5681, 5682 ],
  195520. "attributes": {
  195521. "hdlname": "phy_I bit[0].isd_I genblk2.scap_out",
  195522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:169.21-169.29"
  195523. }
  195524. },
  195525. "phy_I.bit[0].isd_I.phase_sel": {
  195526. "hide_name": 0,
  195527. "bits": [ "0", "0" ],
  195528. "attributes": {
  195529. "hdlname": "phy_I bit[0].isd_I phase_sel",
  195530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:21.20-21.29"
  195531. }
  195532. },
  195533. "phy_I.bit[0].isd_I.q": {
  195534. "hide_name": 0,
  195535. "bits": [ 5678, 5680, 5681, 5682 ],
  195536. "attributes": {
  195537. "hdlname": "phy_I bit[0].isd_I q",
  195538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:19.20-19.21"
  195539. }
  195540. },
  195541. "phy_I.bit[0].isd_I.shift_in[0]": {
  195542. "hide_name": 0,
  195543. "bits": [ 5667, 5668, 5669, 5670 ],
  195544. "attributes": {
  195545. "hdlname": "phy_I bit[0].isd_I shift_in[0]",
  195546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:43.13-43.21"
  195547. }
  195548. },
  195549. "phy_I.bit[0].isd_I.shift_out[0]": {
  195550. "hide_name": 0,
  195551. "bits": [ 5668, 5669, 5670, 5671 ],
  195552. "attributes": {
  195553. "hdlname": "phy_I bit[0].isd_I shift_out[0]",
  195554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:44.13-44.22"
  195555. }
  195556. },
  195557. "phy_I.bit[0].isd_I.sync": {
  195558. "hide_name": 0,
  195559. "bits": [ 5672 ],
  195560. "attributes": {
  195561. "hdlname": "phy_I bit[0].isd_I sync",
  195562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:22.20-22.24"
  195563. }
  195564. },
  195565. "phy_I.bit[0].osd_o": {
  195566. "hide_name": 0,
  195567. "bits": [ 5701, "0" ],
  195568. "attributes": {
  195569. "hdlname": "phy_I bit[0].osd_o",
  195570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:58.15-58.20"
  195571. }
  195572. },
  195573. "phy_I.bit[0].osd_o_I.cap_in": {
  195574. "hide_name": 0,
  195575. "bits": [ 5683, 5686, 5689, 5692 ],
  195576. "attributes": {
  195577. "hdlname": "phy_I bit[0].osd_o_I cap_in",
  195578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  195579. }
  195580. },
  195581. "phy_I.bit[0].osd_o_I.cap_out": {
  195582. "hide_name": 0,
  195583. "bits": [ 5684, 5687, 5690, 5693 ],
  195584. "attributes": {
  195585. "hdlname": "phy_I bit[0].osd_o_I cap_out",
  195586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  195587. }
  195588. },
  195589. "phy_I.bit[0].osd_o_I.clk_1x": {
  195590. "hide_name": 0,
  195591. "bits": [ 42 ],
  195592. "attributes": {
  195593. "hdlname": "phy_I bit[0].osd_o_I clk_1x",
  195594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  195595. }
  195596. },
  195597. "phy_I.bit[0].osd_o_I.clk_4x": {
  195598. "hide_name": 0,
  195599. "bits": [ 5666 ],
  195600. "attributes": {
  195601. "hdlname": "phy_I bit[0].osd_o_I clk_4x",
  195602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  195603. }
  195604. },
  195605. "phy_I.bit[0].osd_o_I.d": {
  195606. "hide_name": 0,
  195607. "bits": [ 5683, 5686, 5689, 5692 ],
  195608. "attributes": {
  195609. "hdlname": "phy_I bit[0].osd_o_I d",
  195610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  195611. }
  195612. },
  195613. "phy_I.bit[0].osd_o_I.genblk1[0].dff_cap_I.c": {
  195614. "hide_name": 0,
  195615. "bits": [ 42 ],
  195616. "attributes": {
  195617. "hdlname": "phy_I bit[0].osd_o_I genblk1[0].dff_cap_I c",
  195618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195619. }
  195620. },
  195621. "phy_I.bit[0].osd_o_I.genblk1[0].dff_cap_I.d": {
  195622. "hide_name": 0,
  195623. "bits": [ 5683 ],
  195624. "attributes": {
  195625. "hdlname": "phy_I bit[0].osd_o_I genblk1[0].dff_cap_I d",
  195626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195627. }
  195628. },
  195629. "phy_I.bit[0].osd_o_I.genblk1[0].dff_cap_I.q": {
  195630. "hide_name": 0,
  195631. "bits": [ 5684 ],
  195632. "attributes": {
  195633. "hdlname": "phy_I bit[0].osd_o_I genblk1[0].dff_cap_I q",
  195634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195635. }
  195636. },
  195637. "phy_I.bit[0].osd_o_I.genblk1[1].dff_cap_I.c": {
  195638. "hide_name": 0,
  195639. "bits": [ 42 ],
  195640. "attributes": {
  195641. "hdlname": "phy_I bit[0].osd_o_I genblk1[1].dff_cap_I c",
  195642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195643. }
  195644. },
  195645. "phy_I.bit[0].osd_o_I.genblk1[1].dff_cap_I.d": {
  195646. "hide_name": 0,
  195647. "bits": [ 5686 ],
  195648. "attributes": {
  195649. "hdlname": "phy_I bit[0].osd_o_I genblk1[1].dff_cap_I d",
  195650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195651. }
  195652. },
  195653. "phy_I.bit[0].osd_o_I.genblk1[1].dff_cap_I.q": {
  195654. "hide_name": 0,
  195655. "bits": [ 5687 ],
  195656. "attributes": {
  195657. "hdlname": "phy_I bit[0].osd_o_I genblk1[1].dff_cap_I q",
  195658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195659. }
  195660. },
  195661. "phy_I.bit[0].osd_o_I.genblk1[2].dff_cap_I.c": {
  195662. "hide_name": 0,
  195663. "bits": [ 42 ],
  195664. "attributes": {
  195665. "hdlname": "phy_I bit[0].osd_o_I genblk1[2].dff_cap_I c",
  195666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195667. }
  195668. },
  195669. "phy_I.bit[0].osd_o_I.genblk1[2].dff_cap_I.d": {
  195670. "hide_name": 0,
  195671. "bits": [ 5689 ],
  195672. "attributes": {
  195673. "hdlname": "phy_I bit[0].osd_o_I genblk1[2].dff_cap_I d",
  195674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195675. }
  195676. },
  195677. "phy_I.bit[0].osd_o_I.genblk1[2].dff_cap_I.q": {
  195678. "hide_name": 0,
  195679. "bits": [ 5690 ],
  195680. "attributes": {
  195681. "hdlname": "phy_I bit[0].osd_o_I genblk1[2].dff_cap_I q",
  195682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195683. }
  195684. },
  195685. "phy_I.bit[0].osd_o_I.genblk1[3].dff_cap_I.c": {
  195686. "hide_name": 0,
  195687. "bits": [ 42 ],
  195688. "attributes": {
  195689. "hdlname": "phy_I bit[0].osd_o_I genblk1[3].dff_cap_I c",
  195690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195691. }
  195692. },
  195693. "phy_I.bit[0].osd_o_I.genblk1[3].dff_cap_I.d": {
  195694. "hide_name": 0,
  195695. "bits": [ 5692 ],
  195696. "attributes": {
  195697. "hdlname": "phy_I bit[0].osd_o_I genblk1[3].dff_cap_I d",
  195698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195699. }
  195700. },
  195701. "phy_I.bit[0].osd_o_I.genblk1[3].dff_cap_I.q": {
  195702. "hide_name": 0,
  195703. "bits": [ 5693 ],
  195704. "attributes": {
  195705. "hdlname": "phy_I bit[0].osd_o_I genblk1[3].dff_cap_I q",
  195706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195707. }
  195708. },
  195709. "phy_I.bit[0].osd_o_I.genblk2[0].dff_shift_I.c": {
  195710. "hide_name": 0,
  195711. "bits": [ 5666 ],
  195712. "attributes": {
  195713. "hdlname": "phy_I bit[0].osd_o_I genblk2[0].dff_shift_I c",
  195714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195715. }
  195716. },
  195717. "phy_I.bit[0].osd_o_I.genblk2[0].dff_shift_I.d": {
  195718. "hide_name": 0,
  195719. "bits": [ 5694 ],
  195720. "attributes": {
  195721. "hdlname": "phy_I bit[0].osd_o_I genblk2[0].dff_shift_I d",
  195722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195723. }
  195724. },
  195725. "phy_I.bit[0].osd_o_I.genblk2[0].dff_shift_I.q": {
  195726. "hide_name": 0,
  195727. "bits": [ 5695 ],
  195728. "attributes": {
  195729. "hdlname": "phy_I bit[0].osd_o_I genblk2[0].dff_shift_I q",
  195730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195731. }
  195732. },
  195733. "phy_I.bit[0].osd_o_I.genblk2[1].dff_shift_I.c": {
  195734. "hide_name": 0,
  195735. "bits": [ 5666 ],
  195736. "attributes": {
  195737. "hdlname": "phy_I bit[0].osd_o_I genblk2[1].dff_shift_I c",
  195738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195739. }
  195740. },
  195741. "phy_I.bit[0].osd_o_I.genblk2[1].dff_shift_I.d": {
  195742. "hide_name": 0,
  195743. "bits": [ 5696 ],
  195744. "attributes": {
  195745. "hdlname": "phy_I bit[0].osd_o_I genblk2[1].dff_shift_I d",
  195746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195747. }
  195748. },
  195749. "phy_I.bit[0].osd_o_I.genblk2[1].dff_shift_I.q": {
  195750. "hide_name": 0,
  195751. "bits": [ 5697 ],
  195752. "attributes": {
  195753. "hdlname": "phy_I bit[0].osd_o_I genblk2[1].dff_shift_I q",
  195754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195755. }
  195756. },
  195757. "phy_I.bit[0].osd_o_I.genblk2[2].dff_shift_I.c": {
  195758. "hide_name": 0,
  195759. "bits": [ 5666 ],
  195760. "attributes": {
  195761. "hdlname": "phy_I bit[0].osd_o_I genblk2[2].dff_shift_I c",
  195762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195763. }
  195764. },
  195765. "phy_I.bit[0].osd_o_I.genblk2[2].dff_shift_I.d": {
  195766. "hide_name": 0,
  195767. "bits": [ 5698 ],
  195768. "attributes": {
  195769. "hdlname": "phy_I bit[0].osd_o_I genblk2[2].dff_shift_I d",
  195770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195771. }
  195772. },
  195773. "phy_I.bit[0].osd_o_I.genblk2[2].dff_shift_I.q": {
  195774. "hide_name": 0,
  195775. "bits": [ 5699 ],
  195776. "attributes": {
  195777. "hdlname": "phy_I bit[0].osd_o_I genblk2[2].dff_shift_I q",
  195778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195779. }
  195780. },
  195781. "phy_I.bit[0].osd_o_I.genblk2[3].dff_shift_I.c": {
  195782. "hide_name": 0,
  195783. "bits": [ 5666 ],
  195784. "attributes": {
  195785. "hdlname": "phy_I bit[0].osd_o_I genblk2[3].dff_shift_I c",
  195786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195787. }
  195788. },
  195789. "phy_I.bit[0].osd_o_I.genblk2[3].dff_shift_I.d": {
  195790. "hide_name": 0,
  195791. "bits": [ 5700 ],
  195792. "attributes": {
  195793. "hdlname": "phy_I bit[0].osd_o_I genblk2[3].dff_shift_I d",
  195794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195795. }
  195796. },
  195797. "phy_I.bit[0].osd_o_I.genblk2[3].dff_shift_I.q": {
  195798. "hide_name": 0,
  195799. "bits": [ 5701 ],
  195800. "attributes": {
  195801. "hdlname": "phy_I bit[0].osd_o_I genblk2[3].dff_shift_I q",
  195802. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195803. }
  195804. },
  195805. "phy_I.bit[0].osd_o_I.q": {
  195806. "hide_name": 0,
  195807. "bits": [ 5701, "0" ],
  195808. "attributes": {
  195809. "hdlname": "phy_I bit[0].osd_o_I q",
  195810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  195811. }
  195812. },
  195813. "phy_I.bit[0].osd_o_I.shift_in": {
  195814. "hide_name": 0,
  195815. "bits": [ 5694, 5696, 5698, 5700 ],
  195816. "attributes": {
  195817. "hdlname": "phy_I bit[0].osd_o_I shift_in",
  195818. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  195819. }
  195820. },
  195821. "phy_I.bit[0].osd_o_I.shift_out": {
  195822. "hide_name": 0,
  195823. "bits": [ 5695, 5697, 5699, 5701 ],
  195824. "attributes": {
  195825. "hdlname": "phy_I bit[0].osd_o_I shift_out",
  195826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  195827. }
  195828. },
  195829. "phy_I.bit[0].osd_o_I.sync": {
  195830. "hide_name": 0,
  195831. "bits": [ 5672 ],
  195832. "attributes": {
  195833. "hdlname": "phy_I bit[0].osd_o_I sync",
  195834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  195835. }
  195836. },
  195837. "phy_I.bit[0].osd_oe": {
  195838. "hide_name": 0,
  195839. "bits": [ 5714, "0" ],
  195840. "attributes": {
  195841. "hdlname": "phy_I bit[0].osd_oe",
  195842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:59.15-59.21"
  195843. }
  195844. },
  195845. "phy_I.bit[0].osd_oe_I.cap_in": {
  195846. "hide_name": 0,
  195847. "bits": [ 5702, 5702, 5702, 5702 ],
  195848. "attributes": {
  195849. "hdlname": "phy_I bit[0].osd_oe_I cap_in",
  195850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  195851. }
  195852. },
  195853. "phy_I.bit[0].osd_oe_I.cap_out": {
  195854. "hide_name": 0,
  195855. "bits": [ 5703, 5704, 5705, 5706 ],
  195856. "attributes": {
  195857. "hdlname": "phy_I bit[0].osd_oe_I cap_out",
  195858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  195859. }
  195860. },
  195861. "phy_I.bit[0].osd_oe_I.clk_1x": {
  195862. "hide_name": 0,
  195863. "bits": [ 42 ],
  195864. "attributes": {
  195865. "hdlname": "phy_I bit[0].osd_oe_I clk_1x",
  195866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  195867. }
  195868. },
  195869. "phy_I.bit[0].osd_oe_I.clk_4x": {
  195870. "hide_name": 0,
  195871. "bits": [ 5666 ],
  195872. "attributes": {
  195873. "hdlname": "phy_I bit[0].osd_oe_I clk_4x",
  195874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  195875. }
  195876. },
  195877. "phy_I.bit[0].osd_oe_I.d": {
  195878. "hide_name": 0,
  195879. "bits": [ 5702, 5702, 5702, 5702 ],
  195880. "attributes": {
  195881. "hdlname": "phy_I bit[0].osd_oe_I d",
  195882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  195883. }
  195884. },
  195885. "phy_I.bit[0].osd_oe_I.genblk1[0].dff_cap_I.c": {
  195886. "hide_name": 0,
  195887. "bits": [ 42 ],
  195888. "attributes": {
  195889. "hdlname": "phy_I bit[0].osd_oe_I genblk1[0].dff_cap_I c",
  195890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195891. }
  195892. },
  195893. "phy_I.bit[0].osd_oe_I.genblk1[0].dff_cap_I.d": {
  195894. "hide_name": 0,
  195895. "bits": [ 5702 ],
  195896. "attributes": {
  195897. "hdlname": "phy_I bit[0].osd_oe_I genblk1[0].dff_cap_I d",
  195898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195899. }
  195900. },
  195901. "phy_I.bit[0].osd_oe_I.genblk1[0].dff_cap_I.q": {
  195902. "hide_name": 0,
  195903. "bits": [ 5703 ],
  195904. "attributes": {
  195905. "hdlname": "phy_I bit[0].osd_oe_I genblk1[0].dff_cap_I q",
  195906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195907. }
  195908. },
  195909. "phy_I.bit[0].osd_oe_I.genblk1[1].dff_cap_I.c": {
  195910. "hide_name": 0,
  195911. "bits": [ 42 ],
  195912. "attributes": {
  195913. "hdlname": "phy_I bit[0].osd_oe_I genblk1[1].dff_cap_I c",
  195914. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195915. }
  195916. },
  195917. "phy_I.bit[0].osd_oe_I.genblk1[1].dff_cap_I.d": {
  195918. "hide_name": 0,
  195919. "bits": [ 5702 ],
  195920. "attributes": {
  195921. "hdlname": "phy_I bit[0].osd_oe_I genblk1[1].dff_cap_I d",
  195922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195923. }
  195924. },
  195925. "phy_I.bit[0].osd_oe_I.genblk1[1].dff_cap_I.q": {
  195926. "hide_name": 0,
  195927. "bits": [ 5704 ],
  195928. "attributes": {
  195929. "hdlname": "phy_I bit[0].osd_oe_I genblk1[1].dff_cap_I q",
  195930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195931. }
  195932. },
  195933. "phy_I.bit[0].osd_oe_I.genblk1[2].dff_cap_I.c": {
  195934. "hide_name": 0,
  195935. "bits": [ 42 ],
  195936. "attributes": {
  195937. "hdlname": "phy_I bit[0].osd_oe_I genblk1[2].dff_cap_I c",
  195938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195939. }
  195940. },
  195941. "phy_I.bit[0].osd_oe_I.genblk1[2].dff_cap_I.d": {
  195942. "hide_name": 0,
  195943. "bits": [ 5702 ],
  195944. "attributes": {
  195945. "hdlname": "phy_I bit[0].osd_oe_I genblk1[2].dff_cap_I d",
  195946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195947. }
  195948. },
  195949. "phy_I.bit[0].osd_oe_I.genblk1[2].dff_cap_I.q": {
  195950. "hide_name": 0,
  195951. "bits": [ 5705 ],
  195952. "attributes": {
  195953. "hdlname": "phy_I bit[0].osd_oe_I genblk1[2].dff_cap_I q",
  195954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195955. }
  195956. },
  195957. "phy_I.bit[0].osd_oe_I.genblk1[3].dff_cap_I.c": {
  195958. "hide_name": 0,
  195959. "bits": [ 42 ],
  195960. "attributes": {
  195961. "hdlname": "phy_I bit[0].osd_oe_I genblk1[3].dff_cap_I c",
  195962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195963. }
  195964. },
  195965. "phy_I.bit[0].osd_oe_I.genblk1[3].dff_cap_I.d": {
  195966. "hide_name": 0,
  195967. "bits": [ 5702 ],
  195968. "attributes": {
  195969. "hdlname": "phy_I bit[0].osd_oe_I genblk1[3].dff_cap_I d",
  195970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195971. }
  195972. },
  195973. "phy_I.bit[0].osd_oe_I.genblk1[3].dff_cap_I.q": {
  195974. "hide_name": 0,
  195975. "bits": [ 5706 ],
  195976. "attributes": {
  195977. "hdlname": "phy_I bit[0].osd_oe_I genblk1[3].dff_cap_I q",
  195978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  195979. }
  195980. },
  195981. "phy_I.bit[0].osd_oe_I.genblk2[0].dff_shift_I.c": {
  195982. "hide_name": 0,
  195983. "bits": [ 5666 ],
  195984. "attributes": {
  195985. "hdlname": "phy_I bit[0].osd_oe_I genblk2[0].dff_shift_I c",
  195986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  195987. }
  195988. },
  195989. "phy_I.bit[0].osd_oe_I.genblk2[0].dff_shift_I.d": {
  195990. "hide_name": 0,
  195991. "bits": [ 5707 ],
  195992. "attributes": {
  195993. "hdlname": "phy_I bit[0].osd_oe_I genblk2[0].dff_shift_I d",
  195994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  195995. }
  195996. },
  195997. "phy_I.bit[0].osd_oe_I.genblk2[0].dff_shift_I.q": {
  195998. "hide_name": 0,
  195999. "bits": [ 5708 ],
  196000. "attributes": {
  196001. "hdlname": "phy_I bit[0].osd_oe_I genblk2[0].dff_shift_I q",
  196002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196003. }
  196004. },
  196005. "phy_I.bit[0].osd_oe_I.genblk2[1].dff_shift_I.c": {
  196006. "hide_name": 0,
  196007. "bits": [ 5666 ],
  196008. "attributes": {
  196009. "hdlname": "phy_I bit[0].osd_oe_I genblk2[1].dff_shift_I c",
  196010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196011. }
  196012. },
  196013. "phy_I.bit[0].osd_oe_I.genblk2[1].dff_shift_I.d": {
  196014. "hide_name": 0,
  196015. "bits": [ 5709 ],
  196016. "attributes": {
  196017. "hdlname": "phy_I bit[0].osd_oe_I genblk2[1].dff_shift_I d",
  196018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196019. }
  196020. },
  196021. "phy_I.bit[0].osd_oe_I.genblk2[1].dff_shift_I.q": {
  196022. "hide_name": 0,
  196023. "bits": [ 5710 ],
  196024. "attributes": {
  196025. "hdlname": "phy_I bit[0].osd_oe_I genblk2[1].dff_shift_I q",
  196026. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196027. }
  196028. },
  196029. "phy_I.bit[0].osd_oe_I.genblk2[2].dff_shift_I.c": {
  196030. "hide_name": 0,
  196031. "bits": [ 5666 ],
  196032. "attributes": {
  196033. "hdlname": "phy_I bit[0].osd_oe_I genblk2[2].dff_shift_I c",
  196034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196035. }
  196036. },
  196037. "phy_I.bit[0].osd_oe_I.genblk2[2].dff_shift_I.d": {
  196038. "hide_name": 0,
  196039. "bits": [ 5711 ],
  196040. "attributes": {
  196041. "hdlname": "phy_I bit[0].osd_oe_I genblk2[2].dff_shift_I d",
  196042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196043. }
  196044. },
  196045. "phy_I.bit[0].osd_oe_I.genblk2[2].dff_shift_I.q": {
  196046. "hide_name": 0,
  196047. "bits": [ 5712 ],
  196048. "attributes": {
  196049. "hdlname": "phy_I bit[0].osd_oe_I genblk2[2].dff_shift_I q",
  196050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196051. }
  196052. },
  196053. "phy_I.bit[0].osd_oe_I.genblk2[3].dff_shift_I.c": {
  196054. "hide_name": 0,
  196055. "bits": [ 5666 ],
  196056. "attributes": {
  196057. "hdlname": "phy_I bit[0].osd_oe_I genblk2[3].dff_shift_I c",
  196058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196059. }
  196060. },
  196061. "phy_I.bit[0].osd_oe_I.genblk2[3].dff_shift_I.d": {
  196062. "hide_name": 0,
  196063. "bits": [ 5713 ],
  196064. "attributes": {
  196065. "hdlname": "phy_I bit[0].osd_oe_I genblk2[3].dff_shift_I d",
  196066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196067. }
  196068. },
  196069. "phy_I.bit[0].osd_oe_I.genblk2[3].dff_shift_I.q": {
  196070. "hide_name": 0,
  196071. "bits": [ 5714 ],
  196072. "attributes": {
  196073. "hdlname": "phy_I bit[0].osd_oe_I genblk2[3].dff_shift_I q",
  196074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196075. }
  196076. },
  196077. "phy_I.bit[0].osd_oe_I.q": {
  196078. "hide_name": 0,
  196079. "bits": [ 5714, "0" ],
  196080. "attributes": {
  196081. "hdlname": "phy_I bit[0].osd_oe_I q",
  196082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  196083. }
  196084. },
  196085. "phy_I.bit[0].osd_oe_I.shift_in": {
  196086. "hide_name": 0,
  196087. "bits": [ 5707, 5709, 5711, 5713 ],
  196088. "attributes": {
  196089. "hdlname": "phy_I bit[0].osd_oe_I shift_in",
  196090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  196091. }
  196092. },
  196093. "phy_I.bit[0].osd_oe_I.shift_out": {
  196094. "hide_name": 0,
  196095. "bits": [ 5708, 5710, 5712, 5714 ],
  196096. "attributes": {
  196097. "hdlname": "phy_I bit[0].osd_oe_I shift_out",
  196098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  196099. }
  196100. },
  196101. "phy_I.bit[0].osd_oe_I.sync": {
  196102. "hide_name": 0,
  196103. "bits": [ 5672 ],
  196104. "attributes": {
  196105. "hdlname": "phy_I bit[0].osd_oe_I sync",
  196106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  196107. }
  196108. },
  196109. "phy_I.bit[1].isd_I.clk_1x": {
  196110. "hide_name": 0,
  196111. "bits": [ 42 ],
  196112. "attributes": {
  196113. "hdlname": "phy_I bit[1].isd_I clk_1x",
  196114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:23.20-23.26"
  196115. }
  196116. },
  196117. "phy_I.bit[1].isd_I.clk_4x": {
  196118. "hide_name": 0,
  196119. "bits": [ 5666 ],
  196120. "attributes": {
  196121. "hdlname": "phy_I bit[1].isd_I clk_4x",
  196122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:24.20-24.26"
  196123. }
  196124. },
  196125. "phy_I.bit[1].isd_I.d": {
  196126. "hide_name": 0,
  196127. "bits": [ 5715, "0" ],
  196128. "attributes": {
  196129. "hdlname": "phy_I bit[1].isd_I d",
  196130. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:18.20-18.21"
  196131. }
  196132. },
  196133. "phy_I.bit[1].isd_I.edge_sel": {
  196134. "hide_name": 0,
  196135. "bits": [ "0" ],
  196136. "attributes": {
  196137. "hdlname": "phy_I bit[1].isd_I edge_sel",
  196138. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:20.20-20.28"
  196139. }
  196140. },
  196141. "phy_I.bit[1].isd_I.fcap_in[0]": {
  196142. "hide_name": 0,
  196143. "bits": [ 5716, 5717, 5718, 5719 ],
  196144. "attributes": {
  196145. "hdlname": "phy_I bit[1].isd_I fcap_in[0]",
  196146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:46.13-46.20"
  196147. }
  196148. },
  196149. "phy_I.bit[1].isd_I.fcap_out[0]": {
  196150. "hide_name": 0,
  196151. "bits": [ 5720, 5721, 5722, 5723 ],
  196152. "attributes": {
  196153. "hdlname": "phy_I bit[1].isd_I fcap_out[0]",
  196154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  196155. }
  196156. },
  196157. "phy_I.bit[1].isd_I.fcap_out[1]": {
  196158. "hide_name": 0,
  196159. "bits": [ "0", "0", "0", "0" ],
  196160. "attributes": {
  196161. "hdlname": "phy_I bit[1].isd_I fcap_out[1]",
  196162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  196163. }
  196164. },
  196165. "phy_I.bit[1].isd_I.genblk1[0].fp.din": {
  196166. "hide_name": 0,
  196167. "bits": [ 5715 ],
  196168. "attributes": {
  196169. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.din",
  196170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:66.10-66.13"
  196171. }
  196172. },
  196173. "phy_I.bit[1].isd_I.genblk1[0].fp.edge_active": {
  196174. "hide_name": 0,
  196175. "bits": [ "1" ],
  196176. "attributes": {
  196177. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.edge_active",
  196178. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:64.10-64.21"
  196179. }
  196180. },
  196181. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.c": {
  196182. "hide_name": 0,
  196183. "bits": [ 5666 ],
  196184. "attributes": {
  196185. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[0].dff_shift_I c",
  196186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196187. }
  196188. },
  196189. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.d": {
  196190. "hide_name": 0,
  196191. "bits": [ 5715 ],
  196192. "attributes": {
  196193. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[0].dff_shift_I d",
  196194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196195. }
  196196. },
  196197. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.q": {
  196198. "hide_name": 0,
  196199. "bits": [ 5716 ],
  196200. "attributes": {
  196201. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[0].dff_shift_I q",
  196202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196203. }
  196204. },
  196205. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.c": {
  196206. "hide_name": 0,
  196207. "bits": [ 5666 ],
  196208. "attributes": {
  196209. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[1].dff_shift_I c",
  196210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196211. }
  196212. },
  196213. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.d": {
  196214. "hide_name": 0,
  196215. "bits": [ 5716 ],
  196216. "attributes": {
  196217. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[1].dff_shift_I d",
  196218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196219. }
  196220. },
  196221. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.q": {
  196222. "hide_name": 0,
  196223. "bits": [ 5717 ],
  196224. "attributes": {
  196225. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[1].dff_shift_I q",
  196226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196227. }
  196228. },
  196229. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.c": {
  196230. "hide_name": 0,
  196231. "bits": [ 5666 ],
  196232. "attributes": {
  196233. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[2].dff_shift_I c",
  196234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196235. }
  196236. },
  196237. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.d": {
  196238. "hide_name": 0,
  196239. "bits": [ 5717 ],
  196240. "attributes": {
  196241. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[2].dff_shift_I d",
  196242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196243. }
  196244. },
  196245. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.q": {
  196246. "hide_name": 0,
  196247. "bits": [ 5718 ],
  196248. "attributes": {
  196249. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[2].dff_shift_I q",
  196250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196251. }
  196252. },
  196253. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.c": {
  196254. "hide_name": 0,
  196255. "bits": [ 5666 ],
  196256. "attributes": {
  196257. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[3].dff_shift_I c",
  196258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196259. }
  196260. },
  196261. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.d": {
  196262. "hide_name": 0,
  196263. "bits": [ 5718 ],
  196264. "attributes": {
  196265. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[3].dff_shift_I d",
  196266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196267. }
  196268. },
  196269. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.q": {
  196270. "hide_name": 0,
  196271. "bits": [ 5719 ],
  196272. "attributes": {
  196273. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk2[3].dff_shift_I q",
  196274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196275. }
  196276. },
  196277. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.c": {
  196278. "hide_name": 0,
  196279. "bits": [ 5666 ],
  196280. "attributes": {
  196281. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[0].dff_shift_I c",
  196282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196283. }
  196284. },
  196285. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.d": {
  196286. "hide_name": 0,
  196287. "bits": [ 5716 ],
  196288. "attributes": {
  196289. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[0].dff_shift_I d",
  196290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196291. }
  196292. },
  196293. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.e": {
  196294. "hide_name": 0,
  196295. "bits": [ 5672 ],
  196296. "attributes": {
  196297. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[0].dff_shift_I e",
  196298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  196299. }
  196300. },
  196301. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.q": {
  196302. "hide_name": 0,
  196303. "bits": [ 5720 ],
  196304. "attributes": {
  196305. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[0].dff_shift_I q",
  196306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196307. }
  196308. },
  196309. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.c": {
  196310. "hide_name": 0,
  196311. "bits": [ 5666 ],
  196312. "attributes": {
  196313. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[1].dff_shift_I c",
  196314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196315. }
  196316. },
  196317. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.d": {
  196318. "hide_name": 0,
  196319. "bits": [ 5717 ],
  196320. "attributes": {
  196321. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[1].dff_shift_I d",
  196322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196323. }
  196324. },
  196325. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.e": {
  196326. "hide_name": 0,
  196327. "bits": [ 5672 ],
  196328. "attributes": {
  196329. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[1].dff_shift_I e",
  196330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  196331. }
  196332. },
  196333. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.q": {
  196334. "hide_name": 0,
  196335. "bits": [ 5721 ],
  196336. "attributes": {
  196337. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[1].dff_shift_I q",
  196338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196339. }
  196340. },
  196341. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.c": {
  196342. "hide_name": 0,
  196343. "bits": [ 5666 ],
  196344. "attributes": {
  196345. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[2].dff_shift_I c",
  196346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196347. }
  196348. },
  196349. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.d": {
  196350. "hide_name": 0,
  196351. "bits": [ 5718 ],
  196352. "attributes": {
  196353. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[2].dff_shift_I d",
  196354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196355. }
  196356. },
  196357. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.e": {
  196358. "hide_name": 0,
  196359. "bits": [ 5672 ],
  196360. "attributes": {
  196361. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[2].dff_shift_I e",
  196362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  196363. }
  196364. },
  196365. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.q": {
  196366. "hide_name": 0,
  196367. "bits": [ 5722 ],
  196368. "attributes": {
  196369. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[2].dff_shift_I q",
  196370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196371. }
  196372. },
  196373. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.c": {
  196374. "hide_name": 0,
  196375. "bits": [ 5666 ],
  196376. "attributes": {
  196377. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[3].dff_shift_I c",
  196378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196379. }
  196380. },
  196381. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.d": {
  196382. "hide_name": 0,
  196383. "bits": [ 5719 ],
  196384. "attributes": {
  196385. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[3].dff_shift_I d",
  196386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196387. }
  196388. },
  196389. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.e": {
  196390. "hide_name": 0,
  196391. "bits": [ 5672 ],
  196392. "attributes": {
  196393. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[3].dff_shift_I e",
  196394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  196395. }
  196396. },
  196397. "phy_I.bit[1].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.q": {
  196398. "hide_name": 0,
  196399. "bits": [ 5723 ],
  196400. "attributes": {
  196401. "hdlname": "phy_I bit[1].isd_I genblk1[0].fp.genblk4[3].dff_shift_I q",
  196402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196403. }
  196404. },
  196405. "phy_I.bit[1].isd_I.genblk2.genblk2[0].dff_scap_I.c": {
  196406. "hide_name": 0,
  196407. "bits": [ 42 ],
  196408. "attributes": {
  196409. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[0].dff_scap_I c",
  196410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196411. }
  196412. },
  196413. "phy_I.bit[1].isd_I.genblk2.genblk2[0].dff_scap_I.d": {
  196414. "hide_name": 0,
  196415. "bits": [ 5720 ],
  196416. "attributes": {
  196417. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[0].dff_scap_I d",
  196418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196419. }
  196420. },
  196421. "phy_I.bit[1].isd_I.genblk2.genblk2[0].dff_scap_I.q": {
  196422. "hide_name": 0,
  196423. "bits": [ 5724 ],
  196424. "attributes": {
  196425. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[0].dff_scap_I q",
  196426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196427. }
  196428. },
  196429. "phy_I.bit[1].isd_I.genblk2.genblk2[1].dff_scap_I.c": {
  196430. "hide_name": 0,
  196431. "bits": [ 42 ],
  196432. "attributes": {
  196433. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[1].dff_scap_I c",
  196434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196435. }
  196436. },
  196437. "phy_I.bit[1].isd_I.genblk2.genblk2[1].dff_scap_I.d": {
  196438. "hide_name": 0,
  196439. "bits": [ 5721 ],
  196440. "attributes": {
  196441. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[1].dff_scap_I d",
  196442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196443. }
  196444. },
  196445. "phy_I.bit[1].isd_I.genblk2.genblk2[1].dff_scap_I.q": {
  196446. "hide_name": 0,
  196447. "bits": [ 5679 ],
  196448. "attributes": {
  196449. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[1].dff_scap_I q",
  196450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196451. }
  196452. },
  196453. "phy_I.bit[1].isd_I.genblk2.genblk2[2].dff_scap_I.c": {
  196454. "hide_name": 0,
  196455. "bits": [ 42 ],
  196456. "attributes": {
  196457. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[2].dff_scap_I c",
  196458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196459. }
  196460. },
  196461. "phy_I.bit[1].isd_I.genblk2.genblk2[2].dff_scap_I.d": {
  196462. "hide_name": 0,
  196463. "bits": [ 5722 ],
  196464. "attributes": {
  196465. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[2].dff_scap_I d",
  196466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196467. }
  196468. },
  196469. "phy_I.bit[1].isd_I.genblk2.genblk2[2].dff_scap_I.q": {
  196470. "hide_name": 0,
  196471. "bits": [ 5725 ],
  196472. "attributes": {
  196473. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[2].dff_scap_I q",
  196474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196475. }
  196476. },
  196477. "phy_I.bit[1].isd_I.genblk2.genblk2[3].dff_scap_I.c": {
  196478. "hide_name": 0,
  196479. "bits": [ 42 ],
  196480. "attributes": {
  196481. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[3].dff_scap_I c",
  196482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196483. }
  196484. },
  196485. "phy_I.bit[1].isd_I.genblk2.genblk2[3].dff_scap_I.d": {
  196486. "hide_name": 0,
  196487. "bits": [ 5723 ],
  196488. "attributes": {
  196489. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[3].dff_scap_I d",
  196490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196491. }
  196492. },
  196493. "phy_I.bit[1].isd_I.genblk2.genblk2[3].dff_scap_I.q": {
  196494. "hide_name": 0,
  196495. "bits": [ 5726 ],
  196496. "attributes": {
  196497. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[3].dff_scap_I q",
  196498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196499. }
  196500. },
  196501. "phy_I.bit[1].isd_I.genblk2.genblk2[4].dff_scap_I.c": {
  196502. "hide_name": 0,
  196503. "bits": [ 42 ],
  196504. "attributes": {
  196505. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[4].dff_scap_I c",
  196506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196507. }
  196508. },
  196509. "phy_I.bit[1].isd_I.genblk2.genblk2[4].dff_scap_I.d": {
  196510. "hide_name": 0,
  196511. "bits": [ 5724 ],
  196512. "attributes": {
  196513. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[4].dff_scap_I d",
  196514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196515. }
  196516. },
  196517. "phy_I.bit[1].isd_I.genblk2.genblk2[4].dff_scap_I.q": {
  196518. "hide_name": 0,
  196519. "bits": [ 5727 ],
  196520. "attributes": {
  196521. "hdlname": "phy_I bit[1].isd_I genblk2.genblk2[4].dff_scap_I q",
  196522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196523. }
  196524. },
  196525. "phy_I.bit[1].isd_I.genblk2.scap_in": {
  196526. "hide_name": 0,
  196527. "bits": [ 5720, 5721, 5722, 5723, 5724 ],
  196528. "attributes": {
  196529. "hdlname": "phy_I bit[1].isd_I genblk2.scap_in",
  196530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:168.21-168.28"
  196531. }
  196532. },
  196533. "phy_I.bit[1].isd_I.genblk2.scap_out": {
  196534. "hide_name": 0,
  196535. "bits": [ 5724, 5679, 5725, 5726, 5727 ],
  196536. "attributes": {
  196537. "hdlname": "phy_I bit[1].isd_I genblk2.scap_out",
  196538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:169.21-169.29"
  196539. }
  196540. },
  196541. "phy_I.bit[1].isd_I.phase_sel": {
  196542. "hide_name": 0,
  196543. "bits": [ "0", "0" ],
  196544. "attributes": {
  196545. "hdlname": "phy_I bit[1].isd_I phase_sel",
  196546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:21.20-21.29"
  196547. }
  196548. },
  196549. "phy_I.bit[1].isd_I.q": {
  196550. "hide_name": 0,
  196551. "bits": [ 5679, 5725, 5726, 5727 ],
  196552. "attributes": {
  196553. "hdlname": "phy_I bit[1].isd_I q",
  196554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:19.20-19.21"
  196555. }
  196556. },
  196557. "phy_I.bit[1].isd_I.shift_in[0]": {
  196558. "hide_name": 0,
  196559. "bits": [ 5715, 5716, 5717, 5718 ],
  196560. "attributes": {
  196561. "hdlname": "phy_I bit[1].isd_I shift_in[0]",
  196562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:43.13-43.21"
  196563. }
  196564. },
  196565. "phy_I.bit[1].isd_I.shift_out[0]": {
  196566. "hide_name": 0,
  196567. "bits": [ 5716, 5717, 5718, 5719 ],
  196568. "attributes": {
  196569. "hdlname": "phy_I bit[1].isd_I shift_out[0]",
  196570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:44.13-44.22"
  196571. }
  196572. },
  196573. "phy_I.bit[1].isd_I.sync": {
  196574. "hide_name": 0,
  196575. "bits": [ 5672 ],
  196576. "attributes": {
  196577. "hdlname": "phy_I bit[1].isd_I sync",
  196578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:22.20-22.24"
  196579. }
  196580. },
  196581. "phy_I.bit[1].osd_o": {
  196582. "hide_name": 0,
  196583. "bits": [ 5762, "0" ],
  196584. "attributes": {
  196585. "hdlname": "phy_I bit[1].osd_o",
  196586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:58.15-58.20"
  196587. }
  196588. },
  196589. "phy_I.bit[1].osd_o_I.cap_in": {
  196590. "hide_name": 0,
  196591. "bits": [ 5729, 5736, 5747, 5685 ],
  196592. "attributes": {
  196593. "hdlname": "phy_I bit[1].osd_o_I cap_in",
  196594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  196595. }
  196596. },
  196597. "phy_I.bit[1].osd_o_I.cap_out": {
  196598. "hide_name": 0,
  196599. "bits": [ 5734, 5746, 5753, 5754 ],
  196600. "attributes": {
  196601. "hdlname": "phy_I bit[1].osd_o_I cap_out",
  196602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  196603. }
  196604. },
  196605. "phy_I.bit[1].osd_o_I.clk_1x": {
  196606. "hide_name": 0,
  196607. "bits": [ 42 ],
  196608. "attributes": {
  196609. "hdlname": "phy_I bit[1].osd_o_I clk_1x",
  196610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  196611. }
  196612. },
  196613. "phy_I.bit[1].osd_o_I.clk_4x": {
  196614. "hide_name": 0,
  196615. "bits": [ 5666 ],
  196616. "attributes": {
  196617. "hdlname": "phy_I bit[1].osd_o_I clk_4x",
  196618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  196619. }
  196620. },
  196621. "phy_I.bit[1].osd_o_I.d": {
  196622. "hide_name": 0,
  196623. "bits": [ 5729, 5736, 5747, 5685 ],
  196624. "attributes": {
  196625. "hdlname": "phy_I bit[1].osd_o_I d",
  196626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  196627. }
  196628. },
  196629. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.c": {
  196630. "hide_name": 0,
  196631. "bits": [ 42 ],
  196632. "attributes": {
  196633. "hdlname": "phy_I bit[1].osd_o_I genblk1[0].dff_cap_I c",
  196634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196635. }
  196636. },
  196637. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d": {
  196638. "hide_name": 0,
  196639. "bits": [ 5729 ],
  196640. "attributes": {
  196641. "hdlname": "phy_I bit[1].osd_o_I genblk1[0].dff_cap_I d",
  196642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196643. }
  196644. },
  196645. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I0_O": {
  196646. "hide_name": 0,
  196647. "bits": [ 5730, 5733, 5732 ],
  196648. "attributes": {
  196649. "force_downto": "00000000000000000000000000000001",
  196650. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196651. }
  196652. },
  196653. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1": {
  196654. "hide_name": 0,
  196655. "bits": [ 254, 5731, 5418, 122 ],
  196656. "attributes": {
  196657. "force_downto": "00000000000000000000000000000001",
  196658. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196659. }
  196660. },
  196661. "phy_I.bit[1].osd_o_I.genblk1[0].dff_cap_I.q": {
  196662. "hide_name": 0,
  196663. "bits": [ 5734 ],
  196664. "attributes": {
  196665. "hdlname": "phy_I bit[1].osd_o_I genblk1[0].dff_cap_I q",
  196666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196667. }
  196668. },
  196669. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.c": {
  196670. "hide_name": 0,
  196671. "bits": [ 42 ],
  196672. "attributes": {
  196673. "hdlname": "phy_I bit[1].osd_o_I genblk1[1].dff_cap_I c",
  196674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196675. }
  196676. },
  196677. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d": {
  196678. "hide_name": 0,
  196679. "bits": [ 5736 ],
  196680. "attributes": {
  196681. "hdlname": "phy_I bit[1].osd_o_I genblk1[1].dff_cap_I d",
  196682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196683. }
  196684. },
  196685. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O": {
  196686. "hide_name": 0,
  196687. "bits": [ 5737, 5738, 5739 ],
  196688. "attributes": {
  196689. "force_downto": "00000000000000000000000000000001",
  196690. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196691. }
  196692. },
  196693. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3": {
  196694. "hide_name": 0,
  196695. "bits": [ 123, 124, 5739 ],
  196696. "attributes": {
  196697. "force_downto": "00000000000000000000000000000001",
  196698. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196699. }
  196700. },
  196701. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3_SB_LUT4_I3_O": {
  196702. "hide_name": 0,
  196703. "bits": [ 5743, 5744, 5741 ],
  196704. "attributes": {
  196705. "force_downto": "00000000000000000000000000000001",
  196706. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196707. }
  196708. },
  196709. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_I3_SB_LUT4_I3_O_SB_LUT4_O_I1": {
  196710. "hide_name": 0,
  196711. "bits": [ 5594, 5742, 5622, 5418 ],
  196712. "attributes": {
  196713. "force_downto": "00000000000000000000000000000001",
  196714. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196715. }
  196716. },
  196717. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1": {
  196718. "hide_name": 0,
  196719. "bits": [ 181, 5745, 5418, 122 ],
  196720. "attributes": {
  196721. "force_downto": "00000000000000000000000000000001",
  196722. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196723. }
  196724. },
  196725. "phy_I.bit[1].osd_o_I.genblk1[1].dff_cap_I.q": {
  196726. "hide_name": 0,
  196727. "bits": [ 5746 ],
  196728. "attributes": {
  196729. "hdlname": "phy_I bit[1].osd_o_I genblk1[1].dff_cap_I q",
  196730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196731. }
  196732. },
  196733. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.c": {
  196734. "hide_name": 0,
  196735. "bits": [ 42 ],
  196736. "attributes": {
  196737. "hdlname": "phy_I bit[1].osd_o_I genblk1[2].dff_cap_I c",
  196738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196739. }
  196740. },
  196741. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d": {
  196742. "hide_name": 0,
  196743. "bits": [ 5747 ],
  196744. "attributes": {
  196745. "hdlname": "phy_I bit[1].osd_o_I genblk1[2].dff_cap_I d",
  196746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196747. }
  196748. },
  196749. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O": {
  196750. "hide_name": 0,
  196751. "bits": [ 5748, 5749, 5750 ],
  196752. "attributes": {
  196753. "force_downto": "00000000000000000000000000000001",
  196754. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196755. }
  196756. },
  196757. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1": {
  196758. "hide_name": 0,
  196759. "bits": [ 250, 5752, 5418, 122 ],
  196760. "attributes": {
  196761. "force_downto": "00000000000000000000000000000001",
  196762. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  196763. }
  196764. },
  196765. "phy_I.bit[1].osd_o_I.genblk1[2].dff_cap_I.q": {
  196766. "hide_name": 0,
  196767. "bits": [ 5753 ],
  196768. "attributes": {
  196769. "hdlname": "phy_I bit[1].osd_o_I genblk1[2].dff_cap_I q",
  196770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196771. }
  196772. },
  196773. "phy_I.bit[1].osd_o_I.genblk1[3].dff_cap_I.c": {
  196774. "hide_name": 0,
  196775. "bits": [ 42 ],
  196776. "attributes": {
  196777. "hdlname": "phy_I bit[1].osd_o_I genblk1[3].dff_cap_I c",
  196778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196779. }
  196780. },
  196781. "phy_I.bit[1].osd_o_I.genblk1[3].dff_cap_I.d": {
  196782. "hide_name": 0,
  196783. "bits": [ 5685 ],
  196784. "attributes": {
  196785. "hdlname": "phy_I bit[1].osd_o_I genblk1[3].dff_cap_I d",
  196786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196787. }
  196788. },
  196789. "phy_I.bit[1].osd_o_I.genblk1[3].dff_cap_I.q": {
  196790. "hide_name": 0,
  196791. "bits": [ 5754 ],
  196792. "attributes": {
  196793. "hdlname": "phy_I bit[1].osd_o_I genblk1[3].dff_cap_I q",
  196794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196795. }
  196796. },
  196797. "phy_I.bit[1].osd_o_I.genblk2[0].dff_shift_I.c": {
  196798. "hide_name": 0,
  196799. "bits": [ 5666 ],
  196800. "attributes": {
  196801. "hdlname": "phy_I bit[1].osd_o_I genblk2[0].dff_shift_I c",
  196802. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196803. }
  196804. },
  196805. "phy_I.bit[1].osd_o_I.genblk2[0].dff_shift_I.d": {
  196806. "hide_name": 0,
  196807. "bits": [ 5755 ],
  196808. "attributes": {
  196809. "hdlname": "phy_I bit[1].osd_o_I genblk2[0].dff_shift_I d",
  196810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196811. }
  196812. },
  196813. "phy_I.bit[1].osd_o_I.genblk2[0].dff_shift_I.q": {
  196814. "hide_name": 0,
  196815. "bits": [ 5756 ],
  196816. "attributes": {
  196817. "hdlname": "phy_I bit[1].osd_o_I genblk2[0].dff_shift_I q",
  196818. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196819. }
  196820. },
  196821. "phy_I.bit[1].osd_o_I.genblk2[1].dff_shift_I.c": {
  196822. "hide_name": 0,
  196823. "bits": [ 5666 ],
  196824. "attributes": {
  196825. "hdlname": "phy_I bit[1].osd_o_I genblk2[1].dff_shift_I c",
  196826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196827. }
  196828. },
  196829. "phy_I.bit[1].osd_o_I.genblk2[1].dff_shift_I.d": {
  196830. "hide_name": 0,
  196831. "bits": [ 5757 ],
  196832. "attributes": {
  196833. "hdlname": "phy_I bit[1].osd_o_I genblk2[1].dff_shift_I d",
  196834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196835. }
  196836. },
  196837. "phy_I.bit[1].osd_o_I.genblk2[1].dff_shift_I.q": {
  196838. "hide_name": 0,
  196839. "bits": [ 5758 ],
  196840. "attributes": {
  196841. "hdlname": "phy_I bit[1].osd_o_I genblk2[1].dff_shift_I q",
  196842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196843. }
  196844. },
  196845. "phy_I.bit[1].osd_o_I.genblk2[2].dff_shift_I.c": {
  196846. "hide_name": 0,
  196847. "bits": [ 5666 ],
  196848. "attributes": {
  196849. "hdlname": "phy_I bit[1].osd_o_I genblk2[2].dff_shift_I c",
  196850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196851. }
  196852. },
  196853. "phy_I.bit[1].osd_o_I.genblk2[2].dff_shift_I.d": {
  196854. "hide_name": 0,
  196855. "bits": [ 5759 ],
  196856. "attributes": {
  196857. "hdlname": "phy_I bit[1].osd_o_I genblk2[2].dff_shift_I d",
  196858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196859. }
  196860. },
  196861. "phy_I.bit[1].osd_o_I.genblk2[2].dff_shift_I.q": {
  196862. "hide_name": 0,
  196863. "bits": [ 5760 ],
  196864. "attributes": {
  196865. "hdlname": "phy_I bit[1].osd_o_I genblk2[2].dff_shift_I q",
  196866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196867. }
  196868. },
  196869. "phy_I.bit[1].osd_o_I.genblk2[3].dff_shift_I.c": {
  196870. "hide_name": 0,
  196871. "bits": [ 5666 ],
  196872. "attributes": {
  196873. "hdlname": "phy_I bit[1].osd_o_I genblk2[3].dff_shift_I c",
  196874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196875. }
  196876. },
  196877. "phy_I.bit[1].osd_o_I.genblk2[3].dff_shift_I.d": {
  196878. "hide_name": 0,
  196879. "bits": [ 5761 ],
  196880. "attributes": {
  196881. "hdlname": "phy_I bit[1].osd_o_I genblk2[3].dff_shift_I d",
  196882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196883. }
  196884. },
  196885. "phy_I.bit[1].osd_o_I.genblk2[3].dff_shift_I.q": {
  196886. "hide_name": 0,
  196887. "bits": [ 5762 ],
  196888. "attributes": {
  196889. "hdlname": "phy_I bit[1].osd_o_I genblk2[3].dff_shift_I q",
  196890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196891. }
  196892. },
  196893. "phy_I.bit[1].osd_o_I.q": {
  196894. "hide_name": 0,
  196895. "bits": [ 5762, "0" ],
  196896. "attributes": {
  196897. "hdlname": "phy_I bit[1].osd_o_I q",
  196898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  196899. }
  196900. },
  196901. "phy_I.bit[1].osd_o_I.shift_in": {
  196902. "hide_name": 0,
  196903. "bits": [ 5755, 5757, 5759, 5761 ],
  196904. "attributes": {
  196905. "hdlname": "phy_I bit[1].osd_o_I shift_in",
  196906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  196907. }
  196908. },
  196909. "phy_I.bit[1].osd_o_I.shift_out": {
  196910. "hide_name": 0,
  196911. "bits": [ 5756, 5758, 5760, 5762 ],
  196912. "attributes": {
  196913. "hdlname": "phy_I bit[1].osd_o_I shift_out",
  196914. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  196915. }
  196916. },
  196917. "phy_I.bit[1].osd_o_I.sync": {
  196918. "hide_name": 0,
  196919. "bits": [ 5672 ],
  196920. "attributes": {
  196921. "hdlname": "phy_I bit[1].osd_o_I sync",
  196922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  196923. }
  196924. },
  196925. "phy_I.bit[1].osd_oe": {
  196926. "hide_name": 0,
  196927. "bits": [ 5774, "0" ],
  196928. "attributes": {
  196929. "hdlname": "phy_I bit[1].osd_oe",
  196930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:59.15-59.21"
  196931. }
  196932. },
  196933. "phy_I.bit[1].osd_oe_I.cap_in": {
  196934. "hide_name": 0,
  196935. "bits": [ 5612, 5612, 5612, 5612 ],
  196936. "attributes": {
  196937. "hdlname": "phy_I bit[1].osd_oe_I cap_in",
  196938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  196939. }
  196940. },
  196941. "phy_I.bit[1].osd_oe_I.cap_out": {
  196942. "hide_name": 0,
  196943. "bits": [ 5763, 5764, 5765, 5766 ],
  196944. "attributes": {
  196945. "hdlname": "phy_I bit[1].osd_oe_I cap_out",
  196946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  196947. }
  196948. },
  196949. "phy_I.bit[1].osd_oe_I.clk_1x": {
  196950. "hide_name": 0,
  196951. "bits": [ 42 ],
  196952. "attributes": {
  196953. "hdlname": "phy_I bit[1].osd_oe_I clk_1x",
  196954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  196955. }
  196956. },
  196957. "phy_I.bit[1].osd_oe_I.clk_4x": {
  196958. "hide_name": 0,
  196959. "bits": [ 5666 ],
  196960. "attributes": {
  196961. "hdlname": "phy_I bit[1].osd_oe_I clk_4x",
  196962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  196963. }
  196964. },
  196965. "phy_I.bit[1].osd_oe_I.d": {
  196966. "hide_name": 0,
  196967. "bits": [ 5612, 5612, 5612, 5612 ],
  196968. "attributes": {
  196969. "hdlname": "phy_I bit[1].osd_oe_I d",
  196970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  196971. }
  196972. },
  196973. "phy_I.bit[1].osd_oe_I.genblk1[0].dff_cap_I.c": {
  196974. "hide_name": 0,
  196975. "bits": [ 42 ],
  196976. "attributes": {
  196977. "hdlname": "phy_I bit[1].osd_oe_I genblk1[0].dff_cap_I c",
  196978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  196979. }
  196980. },
  196981. "phy_I.bit[1].osd_oe_I.genblk1[0].dff_cap_I.d": {
  196982. "hide_name": 0,
  196983. "bits": [ 5612 ],
  196984. "attributes": {
  196985. "hdlname": "phy_I bit[1].osd_oe_I genblk1[0].dff_cap_I d",
  196986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  196987. }
  196988. },
  196989. "phy_I.bit[1].osd_oe_I.genblk1[0].dff_cap_I.q": {
  196990. "hide_name": 0,
  196991. "bits": [ 5763 ],
  196992. "attributes": {
  196993. "hdlname": "phy_I bit[1].osd_oe_I genblk1[0].dff_cap_I q",
  196994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  196995. }
  196996. },
  196997. "phy_I.bit[1].osd_oe_I.genblk1[1].dff_cap_I.c": {
  196998. "hide_name": 0,
  196999. "bits": [ 42 ],
  197000. "attributes": {
  197001. "hdlname": "phy_I bit[1].osd_oe_I genblk1[1].dff_cap_I c",
  197002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197003. }
  197004. },
  197005. "phy_I.bit[1].osd_oe_I.genblk1[1].dff_cap_I.d": {
  197006. "hide_name": 0,
  197007. "bits": [ 5612 ],
  197008. "attributes": {
  197009. "hdlname": "phy_I bit[1].osd_oe_I genblk1[1].dff_cap_I d",
  197010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197011. }
  197012. },
  197013. "phy_I.bit[1].osd_oe_I.genblk1[1].dff_cap_I.q": {
  197014. "hide_name": 0,
  197015. "bits": [ 5764 ],
  197016. "attributes": {
  197017. "hdlname": "phy_I bit[1].osd_oe_I genblk1[1].dff_cap_I q",
  197018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197019. }
  197020. },
  197021. "phy_I.bit[1].osd_oe_I.genblk1[2].dff_cap_I.c": {
  197022. "hide_name": 0,
  197023. "bits": [ 42 ],
  197024. "attributes": {
  197025. "hdlname": "phy_I bit[1].osd_oe_I genblk1[2].dff_cap_I c",
  197026. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197027. }
  197028. },
  197029. "phy_I.bit[1].osd_oe_I.genblk1[2].dff_cap_I.d": {
  197030. "hide_name": 0,
  197031. "bits": [ 5612 ],
  197032. "attributes": {
  197033. "hdlname": "phy_I bit[1].osd_oe_I genblk1[2].dff_cap_I d",
  197034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197035. }
  197036. },
  197037. "phy_I.bit[1].osd_oe_I.genblk1[2].dff_cap_I.q": {
  197038. "hide_name": 0,
  197039. "bits": [ 5765 ],
  197040. "attributes": {
  197041. "hdlname": "phy_I bit[1].osd_oe_I genblk1[2].dff_cap_I q",
  197042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197043. }
  197044. },
  197045. "phy_I.bit[1].osd_oe_I.genblk1[3].dff_cap_I.c": {
  197046. "hide_name": 0,
  197047. "bits": [ 42 ],
  197048. "attributes": {
  197049. "hdlname": "phy_I bit[1].osd_oe_I genblk1[3].dff_cap_I c",
  197050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197051. }
  197052. },
  197053. "phy_I.bit[1].osd_oe_I.genblk1[3].dff_cap_I.d": {
  197054. "hide_name": 0,
  197055. "bits": [ 5612 ],
  197056. "attributes": {
  197057. "hdlname": "phy_I bit[1].osd_oe_I genblk1[3].dff_cap_I d",
  197058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197059. }
  197060. },
  197061. "phy_I.bit[1].osd_oe_I.genblk1[3].dff_cap_I.q": {
  197062. "hide_name": 0,
  197063. "bits": [ 5766 ],
  197064. "attributes": {
  197065. "hdlname": "phy_I bit[1].osd_oe_I genblk1[3].dff_cap_I q",
  197066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197067. }
  197068. },
  197069. "phy_I.bit[1].osd_oe_I.genblk2[0].dff_shift_I.c": {
  197070. "hide_name": 0,
  197071. "bits": [ 5666 ],
  197072. "attributes": {
  197073. "hdlname": "phy_I bit[1].osd_oe_I genblk2[0].dff_shift_I c",
  197074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197075. }
  197076. },
  197077. "phy_I.bit[1].osd_oe_I.genblk2[0].dff_shift_I.d": {
  197078. "hide_name": 0,
  197079. "bits": [ 5767 ],
  197080. "attributes": {
  197081. "hdlname": "phy_I bit[1].osd_oe_I genblk2[0].dff_shift_I d",
  197082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197083. }
  197084. },
  197085. "phy_I.bit[1].osd_oe_I.genblk2[0].dff_shift_I.q": {
  197086. "hide_name": 0,
  197087. "bits": [ 5768 ],
  197088. "attributes": {
  197089. "hdlname": "phy_I bit[1].osd_oe_I genblk2[0].dff_shift_I q",
  197090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197091. }
  197092. },
  197093. "phy_I.bit[1].osd_oe_I.genblk2[1].dff_shift_I.c": {
  197094. "hide_name": 0,
  197095. "bits": [ 5666 ],
  197096. "attributes": {
  197097. "hdlname": "phy_I bit[1].osd_oe_I genblk2[1].dff_shift_I c",
  197098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197099. }
  197100. },
  197101. "phy_I.bit[1].osd_oe_I.genblk2[1].dff_shift_I.d": {
  197102. "hide_name": 0,
  197103. "bits": [ 5769 ],
  197104. "attributes": {
  197105. "hdlname": "phy_I bit[1].osd_oe_I genblk2[1].dff_shift_I d",
  197106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197107. }
  197108. },
  197109. "phy_I.bit[1].osd_oe_I.genblk2[1].dff_shift_I.q": {
  197110. "hide_name": 0,
  197111. "bits": [ 5770 ],
  197112. "attributes": {
  197113. "hdlname": "phy_I bit[1].osd_oe_I genblk2[1].dff_shift_I q",
  197114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197115. }
  197116. },
  197117. "phy_I.bit[1].osd_oe_I.genblk2[2].dff_shift_I.c": {
  197118. "hide_name": 0,
  197119. "bits": [ 5666 ],
  197120. "attributes": {
  197121. "hdlname": "phy_I bit[1].osd_oe_I genblk2[2].dff_shift_I c",
  197122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197123. }
  197124. },
  197125. "phy_I.bit[1].osd_oe_I.genblk2[2].dff_shift_I.d": {
  197126. "hide_name": 0,
  197127. "bits": [ 5771 ],
  197128. "attributes": {
  197129. "hdlname": "phy_I bit[1].osd_oe_I genblk2[2].dff_shift_I d",
  197130. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197131. }
  197132. },
  197133. "phy_I.bit[1].osd_oe_I.genblk2[2].dff_shift_I.q": {
  197134. "hide_name": 0,
  197135. "bits": [ 5772 ],
  197136. "attributes": {
  197137. "hdlname": "phy_I bit[1].osd_oe_I genblk2[2].dff_shift_I q",
  197138. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197139. }
  197140. },
  197141. "phy_I.bit[1].osd_oe_I.genblk2[3].dff_shift_I.c": {
  197142. "hide_name": 0,
  197143. "bits": [ 5666 ],
  197144. "attributes": {
  197145. "hdlname": "phy_I bit[1].osd_oe_I genblk2[3].dff_shift_I c",
  197146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197147. }
  197148. },
  197149. "phy_I.bit[1].osd_oe_I.genblk2[3].dff_shift_I.d": {
  197150. "hide_name": 0,
  197151. "bits": [ 5773 ],
  197152. "attributes": {
  197153. "hdlname": "phy_I bit[1].osd_oe_I genblk2[3].dff_shift_I d",
  197154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197155. }
  197156. },
  197157. "phy_I.bit[1].osd_oe_I.genblk2[3].dff_shift_I.q": {
  197158. "hide_name": 0,
  197159. "bits": [ 5774 ],
  197160. "attributes": {
  197161. "hdlname": "phy_I bit[1].osd_oe_I genblk2[3].dff_shift_I q",
  197162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197163. }
  197164. },
  197165. "phy_I.bit[1].osd_oe_I.q": {
  197166. "hide_name": 0,
  197167. "bits": [ 5774, "0" ],
  197168. "attributes": {
  197169. "hdlname": "phy_I bit[1].osd_oe_I q",
  197170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  197171. }
  197172. },
  197173. "phy_I.bit[1].osd_oe_I.shift_in": {
  197174. "hide_name": 0,
  197175. "bits": [ 5767, 5769, 5771, 5773 ],
  197176. "attributes": {
  197177. "hdlname": "phy_I bit[1].osd_oe_I shift_in",
  197178. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  197179. }
  197180. },
  197181. "phy_I.bit[1].osd_oe_I.shift_out": {
  197182. "hide_name": 0,
  197183. "bits": [ 5768, 5770, 5772, 5774 ],
  197184. "attributes": {
  197185. "hdlname": "phy_I bit[1].osd_oe_I shift_out",
  197186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  197187. }
  197188. },
  197189. "phy_I.bit[1].osd_oe_I.sync": {
  197190. "hide_name": 0,
  197191. "bits": [ 5672 ],
  197192. "attributes": {
  197193. "hdlname": "phy_I bit[1].osd_oe_I sync",
  197194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  197195. }
  197196. },
  197197. "phy_I.bit[2].isd_I.clk_1x": {
  197198. "hide_name": 0,
  197199. "bits": [ 42 ],
  197200. "attributes": {
  197201. "hdlname": "phy_I bit[2].isd_I clk_1x",
  197202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:23.20-23.26"
  197203. }
  197204. },
  197205. "phy_I.bit[2].isd_I.clk_4x": {
  197206. "hide_name": 0,
  197207. "bits": [ 5666 ],
  197208. "attributes": {
  197209. "hdlname": "phy_I bit[2].isd_I clk_4x",
  197210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:24.20-24.26"
  197211. }
  197212. },
  197213. "phy_I.bit[2].isd_I.d": {
  197214. "hide_name": 0,
  197215. "bits": [ 5775, "0" ],
  197216. "attributes": {
  197217. "hdlname": "phy_I bit[2].isd_I d",
  197218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:18.20-18.21"
  197219. }
  197220. },
  197221. "phy_I.bit[2].isd_I.edge_sel": {
  197222. "hide_name": 0,
  197223. "bits": [ "0" ],
  197224. "attributes": {
  197225. "hdlname": "phy_I bit[2].isd_I edge_sel",
  197226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:20.20-20.28"
  197227. }
  197228. },
  197229. "phy_I.bit[2].isd_I.fcap_in[0]": {
  197230. "hide_name": 0,
  197231. "bits": [ 5776, 5777, 5778, 5779 ],
  197232. "attributes": {
  197233. "hdlname": "phy_I bit[2].isd_I fcap_in[0]",
  197234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:46.13-46.20"
  197235. }
  197236. },
  197237. "phy_I.bit[2].isd_I.fcap_out[0]": {
  197238. "hide_name": 0,
  197239. "bits": [ 5780, 5781, 5782, 5783 ],
  197240. "attributes": {
  197241. "hdlname": "phy_I bit[2].isd_I fcap_out[0]",
  197242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  197243. }
  197244. },
  197245. "phy_I.bit[2].isd_I.fcap_out[1]": {
  197246. "hide_name": 0,
  197247. "bits": [ "0", "0", "0", "0" ],
  197248. "attributes": {
  197249. "hdlname": "phy_I bit[2].isd_I fcap_out[1]",
  197250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  197251. }
  197252. },
  197253. "phy_I.bit[2].isd_I.genblk1[0].fp.din": {
  197254. "hide_name": 0,
  197255. "bits": [ 5775 ],
  197256. "attributes": {
  197257. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.din",
  197258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:66.10-66.13"
  197259. }
  197260. },
  197261. "phy_I.bit[2].isd_I.genblk1[0].fp.edge_active": {
  197262. "hide_name": 0,
  197263. "bits": [ "1" ],
  197264. "attributes": {
  197265. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.edge_active",
  197266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:64.10-64.21"
  197267. }
  197268. },
  197269. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.c": {
  197270. "hide_name": 0,
  197271. "bits": [ 5666 ],
  197272. "attributes": {
  197273. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[0].dff_shift_I c",
  197274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197275. }
  197276. },
  197277. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.d": {
  197278. "hide_name": 0,
  197279. "bits": [ 5775 ],
  197280. "attributes": {
  197281. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[0].dff_shift_I d",
  197282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197283. }
  197284. },
  197285. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.q": {
  197286. "hide_name": 0,
  197287. "bits": [ 5776 ],
  197288. "attributes": {
  197289. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[0].dff_shift_I q",
  197290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197291. }
  197292. },
  197293. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.c": {
  197294. "hide_name": 0,
  197295. "bits": [ 5666 ],
  197296. "attributes": {
  197297. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[1].dff_shift_I c",
  197298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197299. }
  197300. },
  197301. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.d": {
  197302. "hide_name": 0,
  197303. "bits": [ 5776 ],
  197304. "attributes": {
  197305. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[1].dff_shift_I d",
  197306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197307. }
  197308. },
  197309. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.q": {
  197310. "hide_name": 0,
  197311. "bits": [ 5777 ],
  197312. "attributes": {
  197313. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[1].dff_shift_I q",
  197314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197315. }
  197316. },
  197317. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.c": {
  197318. "hide_name": 0,
  197319. "bits": [ 5666 ],
  197320. "attributes": {
  197321. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[2].dff_shift_I c",
  197322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197323. }
  197324. },
  197325. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.d": {
  197326. "hide_name": 0,
  197327. "bits": [ 5777 ],
  197328. "attributes": {
  197329. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[2].dff_shift_I d",
  197330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197331. }
  197332. },
  197333. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.q": {
  197334. "hide_name": 0,
  197335. "bits": [ 5778 ],
  197336. "attributes": {
  197337. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[2].dff_shift_I q",
  197338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197339. }
  197340. },
  197341. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.c": {
  197342. "hide_name": 0,
  197343. "bits": [ 5666 ],
  197344. "attributes": {
  197345. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[3].dff_shift_I c",
  197346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197347. }
  197348. },
  197349. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.d": {
  197350. "hide_name": 0,
  197351. "bits": [ 5778 ],
  197352. "attributes": {
  197353. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[3].dff_shift_I d",
  197354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197355. }
  197356. },
  197357. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.q": {
  197358. "hide_name": 0,
  197359. "bits": [ 5779 ],
  197360. "attributes": {
  197361. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk2[3].dff_shift_I q",
  197362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197363. }
  197364. },
  197365. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.c": {
  197366. "hide_name": 0,
  197367. "bits": [ 5666 ],
  197368. "attributes": {
  197369. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[0].dff_shift_I c",
  197370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197371. }
  197372. },
  197373. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.d": {
  197374. "hide_name": 0,
  197375. "bits": [ 5776 ],
  197376. "attributes": {
  197377. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[0].dff_shift_I d",
  197378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197379. }
  197380. },
  197381. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.e": {
  197382. "hide_name": 0,
  197383. "bits": [ 5672 ],
  197384. "attributes": {
  197385. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[0].dff_shift_I e",
  197386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  197387. }
  197388. },
  197389. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.q": {
  197390. "hide_name": 0,
  197391. "bits": [ 5780 ],
  197392. "attributes": {
  197393. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[0].dff_shift_I q",
  197394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197395. }
  197396. },
  197397. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.c": {
  197398. "hide_name": 0,
  197399. "bits": [ 5666 ],
  197400. "attributes": {
  197401. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[1].dff_shift_I c",
  197402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197403. }
  197404. },
  197405. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.d": {
  197406. "hide_name": 0,
  197407. "bits": [ 5777 ],
  197408. "attributes": {
  197409. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[1].dff_shift_I d",
  197410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197411. }
  197412. },
  197413. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.e": {
  197414. "hide_name": 0,
  197415. "bits": [ 5672 ],
  197416. "attributes": {
  197417. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[1].dff_shift_I e",
  197418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  197419. }
  197420. },
  197421. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.q": {
  197422. "hide_name": 0,
  197423. "bits": [ 5781 ],
  197424. "attributes": {
  197425. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[1].dff_shift_I q",
  197426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197427. }
  197428. },
  197429. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.c": {
  197430. "hide_name": 0,
  197431. "bits": [ 5666 ],
  197432. "attributes": {
  197433. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[2].dff_shift_I c",
  197434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197435. }
  197436. },
  197437. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.d": {
  197438. "hide_name": 0,
  197439. "bits": [ 5778 ],
  197440. "attributes": {
  197441. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[2].dff_shift_I d",
  197442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197443. }
  197444. },
  197445. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.e": {
  197446. "hide_name": 0,
  197447. "bits": [ 5672 ],
  197448. "attributes": {
  197449. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[2].dff_shift_I e",
  197450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  197451. }
  197452. },
  197453. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.q": {
  197454. "hide_name": 0,
  197455. "bits": [ 5782 ],
  197456. "attributes": {
  197457. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[2].dff_shift_I q",
  197458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197459. }
  197460. },
  197461. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.c": {
  197462. "hide_name": 0,
  197463. "bits": [ 5666 ],
  197464. "attributes": {
  197465. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[3].dff_shift_I c",
  197466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197467. }
  197468. },
  197469. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.d": {
  197470. "hide_name": 0,
  197471. "bits": [ 5779 ],
  197472. "attributes": {
  197473. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[3].dff_shift_I d",
  197474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197475. }
  197476. },
  197477. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.e": {
  197478. "hide_name": 0,
  197479. "bits": [ 5672 ],
  197480. "attributes": {
  197481. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[3].dff_shift_I e",
  197482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  197483. }
  197484. },
  197485. "phy_I.bit[2].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.q": {
  197486. "hide_name": 0,
  197487. "bits": [ 5783 ],
  197488. "attributes": {
  197489. "hdlname": "phy_I bit[2].isd_I genblk1[0].fp.genblk4[3].dff_shift_I q",
  197490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197491. }
  197492. },
  197493. "phy_I.bit[2].isd_I.genblk2.genblk2[0].dff_scap_I.c": {
  197494. "hide_name": 0,
  197495. "bits": [ 42 ],
  197496. "attributes": {
  197497. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[0].dff_scap_I c",
  197498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197499. }
  197500. },
  197501. "phy_I.bit[2].isd_I.genblk2.genblk2[0].dff_scap_I.d": {
  197502. "hide_name": 0,
  197503. "bits": [ 5780 ],
  197504. "attributes": {
  197505. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[0].dff_scap_I d",
  197506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197507. }
  197508. },
  197509. "phy_I.bit[2].isd_I.genblk2.genblk2[0].dff_scap_I.q": {
  197510. "hide_name": 0,
  197511. "bits": [ 5784 ],
  197512. "attributes": {
  197513. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[0].dff_scap_I q",
  197514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197515. }
  197516. },
  197517. "phy_I.bit[2].isd_I.genblk2.genblk2[1].dff_scap_I.c": {
  197518. "hide_name": 0,
  197519. "bits": [ 42 ],
  197520. "attributes": {
  197521. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[1].dff_scap_I c",
  197522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197523. }
  197524. },
  197525. "phy_I.bit[2].isd_I.genblk2.genblk2[1].dff_scap_I.d": {
  197526. "hide_name": 0,
  197527. "bits": [ 5781 ],
  197528. "attributes": {
  197529. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[1].dff_scap_I d",
  197530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197531. }
  197532. },
  197533. "phy_I.bit[2].isd_I.genblk2.genblk2[1].dff_scap_I.q": {
  197534. "hide_name": 0,
  197535. "bits": [ 5785 ],
  197536. "attributes": {
  197537. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[1].dff_scap_I q",
  197538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197539. }
  197540. },
  197541. "phy_I.bit[2].isd_I.genblk2.genblk2[2].dff_scap_I.c": {
  197542. "hide_name": 0,
  197543. "bits": [ 42 ],
  197544. "attributes": {
  197545. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[2].dff_scap_I c",
  197546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197547. }
  197548. },
  197549. "phy_I.bit[2].isd_I.genblk2.genblk2[2].dff_scap_I.d": {
  197550. "hide_name": 0,
  197551. "bits": [ 5782 ],
  197552. "attributes": {
  197553. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[2].dff_scap_I d",
  197554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197555. }
  197556. },
  197557. "phy_I.bit[2].isd_I.genblk2.genblk2[2].dff_scap_I.q": {
  197558. "hide_name": 0,
  197559. "bits": [ 5786 ],
  197560. "attributes": {
  197561. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[2].dff_scap_I q",
  197562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197563. }
  197564. },
  197565. "phy_I.bit[2].isd_I.genblk2.genblk2[3].dff_scap_I.c": {
  197566. "hide_name": 0,
  197567. "bits": [ 42 ],
  197568. "attributes": {
  197569. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[3].dff_scap_I c",
  197570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197571. }
  197572. },
  197573. "phy_I.bit[2].isd_I.genblk2.genblk2[3].dff_scap_I.d": {
  197574. "hide_name": 0,
  197575. "bits": [ 5783 ],
  197576. "attributes": {
  197577. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[3].dff_scap_I d",
  197578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197579. }
  197580. },
  197581. "phy_I.bit[2].isd_I.genblk2.genblk2[3].dff_scap_I.q": {
  197582. "hide_name": 0,
  197583. "bits": [ 5787 ],
  197584. "attributes": {
  197585. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[3].dff_scap_I q",
  197586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197587. }
  197588. },
  197589. "phy_I.bit[2].isd_I.genblk2.genblk2[4].dff_scap_I.c": {
  197590. "hide_name": 0,
  197591. "bits": [ 42 ],
  197592. "attributes": {
  197593. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[4].dff_scap_I c",
  197594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197595. }
  197596. },
  197597. "phy_I.bit[2].isd_I.genblk2.genblk2[4].dff_scap_I.d": {
  197598. "hide_name": 0,
  197599. "bits": [ 5784 ],
  197600. "attributes": {
  197601. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[4].dff_scap_I d",
  197602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197603. }
  197604. },
  197605. "phy_I.bit[2].isd_I.genblk2.genblk2[4].dff_scap_I.q": {
  197606. "hide_name": 0,
  197607. "bits": [ 5788 ],
  197608. "attributes": {
  197609. "hdlname": "phy_I bit[2].isd_I genblk2.genblk2[4].dff_scap_I q",
  197610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197611. }
  197612. },
  197613. "phy_I.bit[2].isd_I.genblk2.scap_in": {
  197614. "hide_name": 0,
  197615. "bits": [ 5780, 5781, 5782, 5783, 5784 ],
  197616. "attributes": {
  197617. "hdlname": "phy_I bit[2].isd_I genblk2.scap_in",
  197618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:168.21-168.28"
  197619. }
  197620. },
  197621. "phy_I.bit[2].isd_I.genblk2.scap_out": {
  197622. "hide_name": 0,
  197623. "bits": [ 5784, 5785, 5786, 5787, 5788 ],
  197624. "attributes": {
  197625. "hdlname": "phy_I bit[2].isd_I genblk2.scap_out",
  197626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:169.21-169.29"
  197627. }
  197628. },
  197629. "phy_I.bit[2].isd_I.phase_sel": {
  197630. "hide_name": 0,
  197631. "bits": [ "0", "0" ],
  197632. "attributes": {
  197633. "hdlname": "phy_I bit[2].isd_I phase_sel",
  197634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:21.20-21.29"
  197635. }
  197636. },
  197637. "phy_I.bit[2].isd_I.q": {
  197638. "hide_name": 0,
  197639. "bits": [ 5785, 5786, 5787, 5788 ],
  197640. "attributes": {
  197641. "hdlname": "phy_I bit[2].isd_I q",
  197642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:19.20-19.21"
  197643. }
  197644. },
  197645. "phy_I.bit[2].isd_I.shift_in[0]": {
  197646. "hide_name": 0,
  197647. "bits": [ 5775, 5776, 5777, 5778 ],
  197648. "attributes": {
  197649. "hdlname": "phy_I bit[2].isd_I shift_in[0]",
  197650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:43.13-43.21"
  197651. }
  197652. },
  197653. "phy_I.bit[2].isd_I.shift_out[0]": {
  197654. "hide_name": 0,
  197655. "bits": [ 5776, 5777, 5778, 5779 ],
  197656. "attributes": {
  197657. "hdlname": "phy_I bit[2].isd_I shift_out[0]",
  197658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:44.13-44.22"
  197659. }
  197660. },
  197661. "phy_I.bit[2].isd_I.sync": {
  197662. "hide_name": 0,
  197663. "bits": [ 5672 ],
  197664. "attributes": {
  197665. "hdlname": "phy_I bit[2].isd_I sync",
  197666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:22.20-22.24"
  197667. }
  197668. },
  197669. "phy_I.bit[2].osd_o": {
  197670. "hide_name": 0,
  197671. "bits": [ 5883, "0" ],
  197672. "attributes": {
  197673. "hdlname": "phy_I bit[2].osd_o",
  197674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:58.15-58.20"
  197675. }
  197676. },
  197677. "phy_I.bit[2].osd_o_I.cap_in": {
  197678. "hide_name": 0,
  197679. "bits": [ 5790, 5798, 5804, 5688 ],
  197680. "attributes": {
  197681. "hdlname": "phy_I bit[2].osd_o_I cap_in",
  197682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  197683. }
  197684. },
  197685. "phy_I.bit[2].osd_o_I.cap_out": {
  197686. "hide_name": 0,
  197687. "bits": [ 5796, 5802, 5874, 5875 ],
  197688. "attributes": {
  197689. "hdlname": "phy_I bit[2].osd_o_I cap_out",
  197690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  197691. }
  197692. },
  197693. "phy_I.bit[2].osd_o_I.clk_1x": {
  197694. "hide_name": 0,
  197695. "bits": [ 42 ],
  197696. "attributes": {
  197697. "hdlname": "phy_I bit[2].osd_o_I clk_1x",
  197698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  197699. }
  197700. },
  197701. "phy_I.bit[2].osd_o_I.clk_4x": {
  197702. "hide_name": 0,
  197703. "bits": [ 5666 ],
  197704. "attributes": {
  197705. "hdlname": "phy_I bit[2].osd_o_I clk_4x",
  197706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  197707. }
  197708. },
  197709. "phy_I.bit[2].osd_o_I.d": {
  197710. "hide_name": 0,
  197711. "bits": [ 5790, 5798, 5804, 5688 ],
  197712. "attributes": {
  197713. "hdlname": "phy_I bit[2].osd_o_I d",
  197714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  197715. }
  197716. },
  197717. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.c": {
  197718. "hide_name": 0,
  197719. "bits": [ 42 ],
  197720. "attributes": {
  197721. "hdlname": "phy_I bit[2].osd_o_I genblk1[0].dff_cap_I c",
  197722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197723. }
  197724. },
  197725. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d": {
  197726. "hide_name": 0,
  197727. "bits": [ 5790 ],
  197728. "attributes": {
  197729. "hdlname": "phy_I bit[2].osd_o_I genblk1[0].dff_cap_I d",
  197730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197731. }
  197732. },
  197733. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O": {
  197734. "hide_name": 0,
  197735. "bits": [ 5794, 5793, 5791 ],
  197736. "attributes": {
  197737. "force_downto": "00000000000000000000000000000001",
  197738. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197739. }
  197740. },
  197741. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_I1": {
  197742. "hide_name": 0,
  197743. "bits": [ 5580, 5792, 5613, 5418 ],
  197744. "attributes": {
  197745. "force_downto": "00000000000000000000000000000001",
  197746. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197747. }
  197748. },
  197749. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_I2": {
  197750. "hide_name": 0,
  197751. "bits": [ 5584, 5795, 5613, 5418 ],
  197752. "attributes": {
  197753. "force_downto": "00000000000000000000000000000001",
  197754. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197755. }
  197756. },
  197757. "phy_I.bit[2].osd_o_I.genblk1[0].dff_cap_I.q": {
  197758. "hide_name": 0,
  197759. "bits": [ 5796 ],
  197760. "attributes": {
  197761. "hdlname": "phy_I bit[2].osd_o_I genblk1[0].dff_cap_I q",
  197762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197763. }
  197764. },
  197765. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.c": {
  197766. "hide_name": 0,
  197767. "bits": [ 42 ],
  197768. "attributes": {
  197769. "hdlname": "phy_I bit[2].osd_o_I genblk1[1].dff_cap_I c",
  197770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197771. }
  197772. },
  197773. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.d": {
  197774. "hide_name": 0,
  197775. "bits": [ 5798 ],
  197776. "attributes": {
  197777. "hdlname": "phy_I bit[2].osd_o_I genblk1[1].dff_cap_I d",
  197778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197779. }
  197780. },
  197781. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O": {
  197782. "hide_name": 0,
  197783. "bits": [ 5800, 5418, 5801, 5799 ],
  197784. "attributes": {
  197785. "force_downto": "00000000000000000000000000000001",
  197786. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197787. }
  197788. },
  197789. "phy_I.bit[2].osd_o_I.genblk1[1].dff_cap_I.q": {
  197790. "hide_name": 0,
  197791. "bits": [ 5802 ],
  197792. "attributes": {
  197793. "hdlname": "phy_I bit[2].osd_o_I genblk1[1].dff_cap_I q",
  197794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  197795. }
  197796. },
  197797. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.c": {
  197798. "hide_name": 0,
  197799. "bits": [ 42 ],
  197800. "attributes": {
  197801. "hdlname": "phy_I bit[2].osd_o_I genblk1[2].dff_cap_I c",
  197802. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  197803. }
  197804. },
  197805. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d": {
  197806. "hide_name": 0,
  197807. "bits": [ 5804 ],
  197808. "attributes": {
  197809. "hdlname": "phy_I bit[2].osd_o_I genblk1[2].dff_cap_I d",
  197810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  197811. }
  197812. },
  197813. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O": {
  197814. "hide_name": 0,
  197815. "bits": [ 5805, 5806, 5750 ],
  197816. "attributes": {
  197817. "force_downto": "00000000000000000000000000000001",
  197818. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197819. }
  197820. },
  197821. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O": {
  197822. "hide_name": 0,
  197823. "bits": [ 5591, 5589, 5587, 5585, 5583, 5581, 5579, 5577, 5575, 5573, 5607, 5605, 5603, 5601, 5599, 5597, 5595, 5728, 5789, 5839, 5593, 5735, 5797, 5848, 5571, 5740, 5803, 5917, 5569, 5751, 5807, 5854 ],
  197824. "attributes": {
  197825. "force_downto": "00000000000000000000000000000001",
  197826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:702.3-710.10|/usr/bin/../share/yosys/techmap.v:575.21-575.22"
  197827. }
  197828. },
  197829. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_10_I0": {
  197830. "hide_name": 0,
  197831. "bits": [ 5809, 5418, 5810, 5811 ],
  197832. "attributes": {
  197833. "force_downto": "00000000000000000000000000000001",
  197834. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197835. }
  197836. },
  197837. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_11_I0": {
  197838. "hide_name": 0,
  197839. "bits": [ 5812, 5418, 5813, 5814 ],
  197840. "attributes": {
  197841. "force_downto": "00000000000000000000000000000001",
  197842. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197843. }
  197844. },
  197845. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_12_I0": {
  197846. "hide_name": 0,
  197847. "bits": [ 5815, 5418, 5816, 5817 ],
  197848. "attributes": {
  197849. "force_downto": "00000000000000000000000000000001",
  197850. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197851. }
  197852. },
  197853. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_13_I2": {
  197854. "hide_name": 0,
  197855. "bits": [ 259, 122, 5818, 5819 ],
  197856. "attributes": {
  197857. "force_downto": "00000000000000000000000000000001",
  197858. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197859. }
  197860. },
  197861. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_13_I2_SB_LUT4_O_I1": {
  197862. "hide_name": 0,
  197863. "bits": [ 5608, 5820, 5622, 5418 ],
  197864. "attributes": {
  197865. "force_downto": "00000000000000000000000000000001",
  197866. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197867. }
  197868. },
  197869. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_14_I2": {
  197870. "hide_name": 0,
  197871. "bits": [ 260, 122, 5821, 5822 ],
  197872. "attributes": {
  197873. "force_downto": "00000000000000000000000000000001",
  197874. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197875. }
  197876. },
  197877. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_14_I2_SB_LUT4_O_I1": {
  197878. "hide_name": 0,
  197879. "bits": [ 5606, 5823, 5622, 5418 ],
  197880. "attributes": {
  197881. "force_downto": "00000000000000000000000000000001",
  197882. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197883. }
  197884. },
  197885. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15_I1": {
  197886. "hide_name": 0,
  197887. "bits": [ 5824, 5825, 5826 ],
  197888. "attributes": {
  197889. "force_downto": "00000000000000000000000000000001",
  197890. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197891. }
  197892. },
  197893. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_15_I1_SB_LUT4_O_1_I1": {
  197894. "hide_name": 0,
  197895. "bits": [ 184, 5827, 5418, 122 ],
  197896. "attributes": {
  197897. "force_downto": "00000000000000000000000000000001",
  197898. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197899. }
  197900. },
  197901. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16_I1": {
  197902. "hide_name": 0,
  197903. "bits": [ 5828, 5829, 5830 ],
  197904. "attributes": {
  197905. "force_downto": "00000000000000000000000000000001",
  197906. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197907. }
  197908. },
  197909. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_16_I1_SB_LUT4_O_I1": {
  197910. "hide_name": 0,
  197911. "bits": [ 5590, 5831, 5613, 5418 ],
  197912. "attributes": {
  197913. "force_downto": "00000000000000000000000000000001",
  197914. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197915. }
  197916. },
  197917. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17_I1": {
  197918. "hide_name": 0,
  197919. "bits": [ 5832, 5833, 5834 ],
  197920. "attributes": {
  197921. "force_downto": "00000000000000000000000000000001",
  197922. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197923. }
  197924. },
  197925. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_17_I1_SB_LUT4_O_I1": {
  197926. "hide_name": 0,
  197927. "bits": [ 5588, 5835, 5613, 5418 ],
  197928. "attributes": {
  197929. "force_downto": "00000000000000000000000000000001",
  197930. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197931. }
  197932. },
  197933. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18_I1": {
  197934. "hide_name": 0,
  197935. "bits": [ 5836, 5837, 5838 ],
  197936. "attributes": {
  197937. "force_downto": "00000000000000000000000000000001",
  197938. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197939. }
  197940. },
  197941. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_18_I1_SB_LUT4_O_1_I1": {
  197942. "hide_name": 0,
  197943. "bits": [ 187, 5840, 5418, 122 ],
  197944. "attributes": {
  197945. "force_downto": "00000000000000000000000000000001",
  197946. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197947. }
  197948. },
  197949. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_19_I1": {
  197950. "hide_name": 0,
  197951. "bits": [ 5841, 5842, 5843 ],
  197952. "attributes": {
  197953. "force_downto": "00000000000000000000000000000001",
  197954. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197955. }
  197956. },
  197957. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_1_I1": {
  197958. "hide_name": 0,
  197959. "bits": [ 194, 5808, 5418, 122 ],
  197960. "attributes": {
  197961. "force_downto": "00000000000000000000000000000001",
  197962. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197963. }
  197964. },
  197965. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_25_I2": {
  197966. "hide_name": 0,
  197967. "bits": [ 5572, 5622, 5849, 5850 ],
  197968. "attributes": {
  197969. "force_downto": "00000000000000000000000000000001",
  197970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197971. }
  197972. },
  197973. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_25_I2_SB_LUT4_O_I1": {
  197974. "hide_name": 0,
  197975. "bits": [ 249, 5851, 5418, 122 ],
  197976. "attributes": {
  197977. "force_downto": "00000000000000000000000000000001",
  197978. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197979. }
  197980. },
  197981. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_27_I1": {
  197982. "hide_name": 0,
  197983. "bits": [ 192, 5855, 5418, 122 ],
  197984. "attributes": {
  197985. "force_downto": "00000000000000000000000000000001",
  197986. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197987. }
  197988. },
  197989. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_2_I1": {
  197990. "hide_name": 0,
  197991. "bits": [ 195, 5844, 5418, 122 ],
  197992. "attributes": {
  197993. "force_downto": "00000000000000000000000000000001",
  197994. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  197995. }
  197996. },
  197997. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_3_I3": {
  197998. "hide_name": 0,
  197999. "bits": [ 261, 122, 5856 ],
  198000. "attributes": {
  198001. "force_downto": "00000000000000000000000000000001",
  198002. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198003. }
  198004. },
  198005. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_3_I3_SB_LUT4_O_I1": {
  198006. "hide_name": 0,
  198007. "bits": [ 5592, 5857, 5622, 5418 ],
  198008. "attributes": {
  198009. "force_downto": "00000000000000000000000000000001",
  198010. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198011. }
  198012. },
  198013. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_4_I0": {
  198014. "hide_name": 0,
  198015. "bits": [ 5858, 5418, 5859, 5860 ],
  198016. "attributes": {
  198017. "force_downto": "00000000000000000000000000000001",
  198018. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198019. }
  198020. },
  198021. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_5_I2": {
  198022. "hide_name": 0,
  198023. "bits": [ 5588, 5622, 5861, 5862 ],
  198024. "attributes": {
  198025. "force_downto": "00000000000000000000000000000001",
  198026. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198027. }
  198028. },
  198029. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_5_I2_SB_LUT4_O_I1": {
  198030. "hide_name": 0,
  198031. "bits": [ 153, 5863, 5419, 5418 ],
  198032. "attributes": {
  198033. "force_downto": "00000000000000000000000000000001",
  198034. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198035. }
  198036. },
  198037. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_6_I0": {
  198038. "hide_name": 0,
  198039. "bits": [ 5864, 5418, 5865, 5866 ],
  198040. "attributes": {
  198041. "force_downto": "00000000000000000000000000000001",
  198042. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198043. }
  198044. },
  198045. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_8_I2": {
  198046. "hide_name": 0,
  198047. "bits": [ 5582, 5622, 5867, 5868 ],
  198048. "attributes": {
  198049. "force_downto": "00000000000000000000000000000001",
  198050. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198051. }
  198052. },
  198053. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_8_I2_SB_LUT4_O_I1": {
  198054. "hide_name": 0,
  198055. "bits": [ 156, 5869, 5419, 5418 ],
  198056. "attributes": {
  198057. "force_downto": "00000000000000000000000000000001",
  198058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198059. }
  198060. },
  198061. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_I1_O_SB_LUT4_O_9_I0": {
  198062. "hide_name": 0,
  198063. "bits": [ 5870, 5418, 5871, 5872 ],
  198064. "attributes": {
  198065. "force_downto": "00000000000000000000000000000001",
  198066. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198067. }
  198068. },
  198069. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1": {
  198070. "hide_name": 0,
  198071. "bits": [ 251, 5873, 5418, 122 ],
  198072. "attributes": {
  198073. "force_downto": "00000000000000000000000000000001",
  198074. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  198075. }
  198076. },
  198077. "phy_I.bit[2].osd_o_I.genblk1[2].dff_cap_I.q": {
  198078. "hide_name": 0,
  198079. "bits": [ 5874 ],
  198080. "attributes": {
  198081. "hdlname": "phy_I bit[2].osd_o_I genblk1[2].dff_cap_I q",
  198082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198083. }
  198084. },
  198085. "phy_I.bit[2].osd_o_I.genblk1[3].dff_cap_I.c": {
  198086. "hide_name": 0,
  198087. "bits": [ 42 ],
  198088. "attributes": {
  198089. "hdlname": "phy_I bit[2].osd_o_I genblk1[3].dff_cap_I c",
  198090. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198091. }
  198092. },
  198093. "phy_I.bit[2].osd_o_I.genblk1[3].dff_cap_I.d": {
  198094. "hide_name": 0,
  198095. "bits": [ 5688 ],
  198096. "attributes": {
  198097. "hdlname": "phy_I bit[2].osd_o_I genblk1[3].dff_cap_I d",
  198098. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198099. }
  198100. },
  198101. "phy_I.bit[2].osd_o_I.genblk1[3].dff_cap_I.q": {
  198102. "hide_name": 0,
  198103. "bits": [ 5875 ],
  198104. "attributes": {
  198105. "hdlname": "phy_I bit[2].osd_o_I genblk1[3].dff_cap_I q",
  198106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198107. }
  198108. },
  198109. "phy_I.bit[2].osd_o_I.genblk2[0].dff_shift_I.c": {
  198110. "hide_name": 0,
  198111. "bits": [ 5666 ],
  198112. "attributes": {
  198113. "hdlname": "phy_I bit[2].osd_o_I genblk2[0].dff_shift_I c",
  198114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198115. }
  198116. },
  198117. "phy_I.bit[2].osd_o_I.genblk2[0].dff_shift_I.d": {
  198118. "hide_name": 0,
  198119. "bits": [ 5876 ],
  198120. "attributes": {
  198121. "hdlname": "phy_I bit[2].osd_o_I genblk2[0].dff_shift_I d",
  198122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198123. }
  198124. },
  198125. "phy_I.bit[2].osd_o_I.genblk2[0].dff_shift_I.q": {
  198126. "hide_name": 0,
  198127. "bits": [ 5877 ],
  198128. "attributes": {
  198129. "hdlname": "phy_I bit[2].osd_o_I genblk2[0].dff_shift_I q",
  198130. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198131. }
  198132. },
  198133. "phy_I.bit[2].osd_o_I.genblk2[1].dff_shift_I.c": {
  198134. "hide_name": 0,
  198135. "bits": [ 5666 ],
  198136. "attributes": {
  198137. "hdlname": "phy_I bit[2].osd_o_I genblk2[1].dff_shift_I c",
  198138. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198139. }
  198140. },
  198141. "phy_I.bit[2].osd_o_I.genblk2[1].dff_shift_I.d": {
  198142. "hide_name": 0,
  198143. "bits": [ 5878 ],
  198144. "attributes": {
  198145. "hdlname": "phy_I bit[2].osd_o_I genblk2[1].dff_shift_I d",
  198146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198147. }
  198148. },
  198149. "phy_I.bit[2].osd_o_I.genblk2[1].dff_shift_I.q": {
  198150. "hide_name": 0,
  198151. "bits": [ 5879 ],
  198152. "attributes": {
  198153. "hdlname": "phy_I bit[2].osd_o_I genblk2[1].dff_shift_I q",
  198154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198155. }
  198156. },
  198157. "phy_I.bit[2].osd_o_I.genblk2[2].dff_shift_I.c": {
  198158. "hide_name": 0,
  198159. "bits": [ 5666 ],
  198160. "attributes": {
  198161. "hdlname": "phy_I bit[2].osd_o_I genblk2[2].dff_shift_I c",
  198162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198163. }
  198164. },
  198165. "phy_I.bit[2].osd_o_I.genblk2[2].dff_shift_I.d": {
  198166. "hide_name": 0,
  198167. "bits": [ 5880 ],
  198168. "attributes": {
  198169. "hdlname": "phy_I bit[2].osd_o_I genblk2[2].dff_shift_I d",
  198170. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198171. }
  198172. },
  198173. "phy_I.bit[2].osd_o_I.genblk2[2].dff_shift_I.q": {
  198174. "hide_name": 0,
  198175. "bits": [ 5881 ],
  198176. "attributes": {
  198177. "hdlname": "phy_I bit[2].osd_o_I genblk2[2].dff_shift_I q",
  198178. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198179. }
  198180. },
  198181. "phy_I.bit[2].osd_o_I.genblk2[3].dff_shift_I.c": {
  198182. "hide_name": 0,
  198183. "bits": [ 5666 ],
  198184. "attributes": {
  198185. "hdlname": "phy_I bit[2].osd_o_I genblk2[3].dff_shift_I c",
  198186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198187. }
  198188. },
  198189. "phy_I.bit[2].osd_o_I.genblk2[3].dff_shift_I.d": {
  198190. "hide_name": 0,
  198191. "bits": [ 5882 ],
  198192. "attributes": {
  198193. "hdlname": "phy_I bit[2].osd_o_I genblk2[3].dff_shift_I d",
  198194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198195. }
  198196. },
  198197. "phy_I.bit[2].osd_o_I.genblk2[3].dff_shift_I.q": {
  198198. "hide_name": 0,
  198199. "bits": [ 5883 ],
  198200. "attributes": {
  198201. "hdlname": "phy_I bit[2].osd_o_I genblk2[3].dff_shift_I q",
  198202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198203. }
  198204. },
  198205. "phy_I.bit[2].osd_o_I.q": {
  198206. "hide_name": 0,
  198207. "bits": [ 5883, "0" ],
  198208. "attributes": {
  198209. "hdlname": "phy_I bit[2].osd_o_I q",
  198210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  198211. }
  198212. },
  198213. "phy_I.bit[2].osd_o_I.shift_in": {
  198214. "hide_name": 0,
  198215. "bits": [ 5876, 5878, 5880, 5882 ],
  198216. "attributes": {
  198217. "hdlname": "phy_I bit[2].osd_o_I shift_in",
  198218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  198219. }
  198220. },
  198221. "phy_I.bit[2].osd_o_I.shift_out": {
  198222. "hide_name": 0,
  198223. "bits": [ 5877, 5879, 5881, 5883 ],
  198224. "attributes": {
  198225. "hdlname": "phy_I bit[2].osd_o_I shift_out",
  198226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  198227. }
  198228. },
  198229. "phy_I.bit[2].osd_o_I.sync": {
  198230. "hide_name": 0,
  198231. "bits": [ 5672 ],
  198232. "attributes": {
  198233. "hdlname": "phy_I bit[2].osd_o_I sync",
  198234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  198235. }
  198236. },
  198237. "phy_I.bit[2].osd_oe": {
  198238. "hide_name": 0,
  198239. "bits": [ 5895, "0" ],
  198240. "attributes": {
  198241. "hdlname": "phy_I bit[2].osd_oe",
  198242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:59.15-59.21"
  198243. }
  198244. },
  198245. "phy_I.bit[2].osd_oe_I.cap_in": {
  198246. "hide_name": 0,
  198247. "bits": [ 5612, 5612, 5612, 5612 ],
  198248. "attributes": {
  198249. "hdlname": "phy_I bit[2].osd_oe_I cap_in",
  198250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  198251. }
  198252. },
  198253. "phy_I.bit[2].osd_oe_I.cap_out": {
  198254. "hide_name": 0,
  198255. "bits": [ 5884, 5885, 5886, 5887 ],
  198256. "attributes": {
  198257. "hdlname": "phy_I bit[2].osd_oe_I cap_out",
  198258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  198259. }
  198260. },
  198261. "phy_I.bit[2].osd_oe_I.clk_1x": {
  198262. "hide_name": 0,
  198263. "bits": [ 42 ],
  198264. "attributes": {
  198265. "hdlname": "phy_I bit[2].osd_oe_I clk_1x",
  198266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  198267. }
  198268. },
  198269. "phy_I.bit[2].osd_oe_I.clk_4x": {
  198270. "hide_name": 0,
  198271. "bits": [ 5666 ],
  198272. "attributes": {
  198273. "hdlname": "phy_I bit[2].osd_oe_I clk_4x",
  198274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  198275. }
  198276. },
  198277. "phy_I.bit[2].osd_oe_I.d": {
  198278. "hide_name": 0,
  198279. "bits": [ 5612, 5612, 5612, 5612 ],
  198280. "attributes": {
  198281. "hdlname": "phy_I bit[2].osd_oe_I d",
  198282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  198283. }
  198284. },
  198285. "phy_I.bit[2].osd_oe_I.genblk1[0].dff_cap_I.c": {
  198286. "hide_name": 0,
  198287. "bits": [ 42 ],
  198288. "attributes": {
  198289. "hdlname": "phy_I bit[2].osd_oe_I genblk1[0].dff_cap_I c",
  198290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198291. }
  198292. },
  198293. "phy_I.bit[2].osd_oe_I.genblk1[0].dff_cap_I.d": {
  198294. "hide_name": 0,
  198295. "bits": [ 5612 ],
  198296. "attributes": {
  198297. "hdlname": "phy_I bit[2].osd_oe_I genblk1[0].dff_cap_I d",
  198298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198299. }
  198300. },
  198301. "phy_I.bit[2].osd_oe_I.genblk1[0].dff_cap_I.q": {
  198302. "hide_name": 0,
  198303. "bits": [ 5884 ],
  198304. "attributes": {
  198305. "hdlname": "phy_I bit[2].osd_oe_I genblk1[0].dff_cap_I q",
  198306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198307. }
  198308. },
  198309. "phy_I.bit[2].osd_oe_I.genblk1[1].dff_cap_I.c": {
  198310. "hide_name": 0,
  198311. "bits": [ 42 ],
  198312. "attributes": {
  198313. "hdlname": "phy_I bit[2].osd_oe_I genblk1[1].dff_cap_I c",
  198314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198315. }
  198316. },
  198317. "phy_I.bit[2].osd_oe_I.genblk1[1].dff_cap_I.d": {
  198318. "hide_name": 0,
  198319. "bits": [ 5612 ],
  198320. "attributes": {
  198321. "hdlname": "phy_I bit[2].osd_oe_I genblk1[1].dff_cap_I d",
  198322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198323. }
  198324. },
  198325. "phy_I.bit[2].osd_oe_I.genblk1[1].dff_cap_I.q": {
  198326. "hide_name": 0,
  198327. "bits": [ 5885 ],
  198328. "attributes": {
  198329. "hdlname": "phy_I bit[2].osd_oe_I genblk1[1].dff_cap_I q",
  198330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198331. }
  198332. },
  198333. "phy_I.bit[2].osd_oe_I.genblk1[2].dff_cap_I.c": {
  198334. "hide_name": 0,
  198335. "bits": [ 42 ],
  198336. "attributes": {
  198337. "hdlname": "phy_I bit[2].osd_oe_I genblk1[2].dff_cap_I c",
  198338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198339. }
  198340. },
  198341. "phy_I.bit[2].osd_oe_I.genblk1[2].dff_cap_I.d": {
  198342. "hide_name": 0,
  198343. "bits": [ 5612 ],
  198344. "attributes": {
  198345. "hdlname": "phy_I bit[2].osd_oe_I genblk1[2].dff_cap_I d",
  198346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198347. }
  198348. },
  198349. "phy_I.bit[2].osd_oe_I.genblk1[2].dff_cap_I.q": {
  198350. "hide_name": 0,
  198351. "bits": [ 5886 ],
  198352. "attributes": {
  198353. "hdlname": "phy_I bit[2].osd_oe_I genblk1[2].dff_cap_I q",
  198354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198355. }
  198356. },
  198357. "phy_I.bit[2].osd_oe_I.genblk1[3].dff_cap_I.c": {
  198358. "hide_name": 0,
  198359. "bits": [ 42 ],
  198360. "attributes": {
  198361. "hdlname": "phy_I bit[2].osd_oe_I genblk1[3].dff_cap_I c",
  198362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198363. }
  198364. },
  198365. "phy_I.bit[2].osd_oe_I.genblk1[3].dff_cap_I.d": {
  198366. "hide_name": 0,
  198367. "bits": [ 5612 ],
  198368. "attributes": {
  198369. "hdlname": "phy_I bit[2].osd_oe_I genblk1[3].dff_cap_I d",
  198370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198371. }
  198372. },
  198373. "phy_I.bit[2].osd_oe_I.genblk1[3].dff_cap_I.q": {
  198374. "hide_name": 0,
  198375. "bits": [ 5887 ],
  198376. "attributes": {
  198377. "hdlname": "phy_I bit[2].osd_oe_I genblk1[3].dff_cap_I q",
  198378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198379. }
  198380. },
  198381. "phy_I.bit[2].osd_oe_I.genblk2[0].dff_shift_I.c": {
  198382. "hide_name": 0,
  198383. "bits": [ 5666 ],
  198384. "attributes": {
  198385. "hdlname": "phy_I bit[2].osd_oe_I genblk2[0].dff_shift_I c",
  198386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198387. }
  198388. },
  198389. "phy_I.bit[2].osd_oe_I.genblk2[0].dff_shift_I.d": {
  198390. "hide_name": 0,
  198391. "bits": [ 5888 ],
  198392. "attributes": {
  198393. "hdlname": "phy_I bit[2].osd_oe_I genblk2[0].dff_shift_I d",
  198394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198395. }
  198396. },
  198397. "phy_I.bit[2].osd_oe_I.genblk2[0].dff_shift_I.q": {
  198398. "hide_name": 0,
  198399. "bits": [ 5889 ],
  198400. "attributes": {
  198401. "hdlname": "phy_I bit[2].osd_oe_I genblk2[0].dff_shift_I q",
  198402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198403. }
  198404. },
  198405. "phy_I.bit[2].osd_oe_I.genblk2[1].dff_shift_I.c": {
  198406. "hide_name": 0,
  198407. "bits": [ 5666 ],
  198408. "attributes": {
  198409. "hdlname": "phy_I bit[2].osd_oe_I genblk2[1].dff_shift_I c",
  198410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198411. }
  198412. },
  198413. "phy_I.bit[2].osd_oe_I.genblk2[1].dff_shift_I.d": {
  198414. "hide_name": 0,
  198415. "bits": [ 5890 ],
  198416. "attributes": {
  198417. "hdlname": "phy_I bit[2].osd_oe_I genblk2[1].dff_shift_I d",
  198418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198419. }
  198420. },
  198421. "phy_I.bit[2].osd_oe_I.genblk2[1].dff_shift_I.q": {
  198422. "hide_name": 0,
  198423. "bits": [ 5891 ],
  198424. "attributes": {
  198425. "hdlname": "phy_I bit[2].osd_oe_I genblk2[1].dff_shift_I q",
  198426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198427. }
  198428. },
  198429. "phy_I.bit[2].osd_oe_I.genblk2[2].dff_shift_I.c": {
  198430. "hide_name": 0,
  198431. "bits": [ 5666 ],
  198432. "attributes": {
  198433. "hdlname": "phy_I bit[2].osd_oe_I genblk2[2].dff_shift_I c",
  198434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198435. }
  198436. },
  198437. "phy_I.bit[2].osd_oe_I.genblk2[2].dff_shift_I.d": {
  198438. "hide_name": 0,
  198439. "bits": [ 5892 ],
  198440. "attributes": {
  198441. "hdlname": "phy_I bit[2].osd_oe_I genblk2[2].dff_shift_I d",
  198442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198443. }
  198444. },
  198445. "phy_I.bit[2].osd_oe_I.genblk2[2].dff_shift_I.q": {
  198446. "hide_name": 0,
  198447. "bits": [ 5893 ],
  198448. "attributes": {
  198449. "hdlname": "phy_I bit[2].osd_oe_I genblk2[2].dff_shift_I q",
  198450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198451. }
  198452. },
  198453. "phy_I.bit[2].osd_oe_I.genblk2[3].dff_shift_I.c": {
  198454. "hide_name": 0,
  198455. "bits": [ 5666 ],
  198456. "attributes": {
  198457. "hdlname": "phy_I bit[2].osd_oe_I genblk2[3].dff_shift_I c",
  198458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198459. }
  198460. },
  198461. "phy_I.bit[2].osd_oe_I.genblk2[3].dff_shift_I.d": {
  198462. "hide_name": 0,
  198463. "bits": [ 5894 ],
  198464. "attributes": {
  198465. "hdlname": "phy_I bit[2].osd_oe_I genblk2[3].dff_shift_I d",
  198466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198467. }
  198468. },
  198469. "phy_I.bit[2].osd_oe_I.genblk2[3].dff_shift_I.q": {
  198470. "hide_name": 0,
  198471. "bits": [ 5895 ],
  198472. "attributes": {
  198473. "hdlname": "phy_I bit[2].osd_oe_I genblk2[3].dff_shift_I q",
  198474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198475. }
  198476. },
  198477. "phy_I.bit[2].osd_oe_I.q": {
  198478. "hide_name": 0,
  198479. "bits": [ 5895, "0" ],
  198480. "attributes": {
  198481. "hdlname": "phy_I bit[2].osd_oe_I q",
  198482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  198483. }
  198484. },
  198485. "phy_I.bit[2].osd_oe_I.shift_in": {
  198486. "hide_name": 0,
  198487. "bits": [ 5888, 5890, 5892, 5894 ],
  198488. "attributes": {
  198489. "hdlname": "phy_I bit[2].osd_oe_I shift_in",
  198490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  198491. }
  198492. },
  198493. "phy_I.bit[2].osd_oe_I.shift_out": {
  198494. "hide_name": 0,
  198495. "bits": [ 5889, 5891, 5893, 5895 ],
  198496. "attributes": {
  198497. "hdlname": "phy_I bit[2].osd_oe_I shift_out",
  198498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  198499. }
  198500. },
  198501. "phy_I.bit[2].osd_oe_I.sync": {
  198502. "hide_name": 0,
  198503. "bits": [ 5672 ],
  198504. "attributes": {
  198505. "hdlname": "phy_I bit[2].osd_oe_I sync",
  198506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  198507. }
  198508. },
  198509. "phy_I.bit[3].isd_I.clk_1x": {
  198510. "hide_name": 0,
  198511. "bits": [ 42 ],
  198512. "attributes": {
  198513. "hdlname": "phy_I bit[3].isd_I clk_1x",
  198514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:23.20-23.26"
  198515. }
  198516. },
  198517. "phy_I.bit[3].isd_I.clk_4x": {
  198518. "hide_name": 0,
  198519. "bits": [ 5666 ],
  198520. "attributes": {
  198521. "hdlname": "phy_I bit[3].isd_I clk_4x",
  198522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:24.20-24.26"
  198523. }
  198524. },
  198525. "phy_I.bit[3].isd_I.d": {
  198526. "hide_name": 0,
  198527. "bits": [ 5896, "0" ],
  198528. "attributes": {
  198529. "hdlname": "phy_I bit[3].isd_I d",
  198530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:18.20-18.21"
  198531. }
  198532. },
  198533. "phy_I.bit[3].isd_I.edge_sel": {
  198534. "hide_name": 0,
  198535. "bits": [ "0" ],
  198536. "attributes": {
  198537. "hdlname": "phy_I bit[3].isd_I edge_sel",
  198538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:20.20-20.28"
  198539. }
  198540. },
  198541. "phy_I.bit[3].isd_I.fcap_in[0]": {
  198542. "hide_name": 0,
  198543. "bits": [ 5897, 5898, 5899, 5900 ],
  198544. "attributes": {
  198545. "hdlname": "phy_I bit[3].isd_I fcap_in[0]",
  198546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:46.13-46.20"
  198547. }
  198548. },
  198549. "phy_I.bit[3].isd_I.fcap_out[0]": {
  198550. "hide_name": 0,
  198551. "bits": [ 5901, 5902, 5903, 5904 ],
  198552. "attributes": {
  198553. "hdlname": "phy_I bit[3].isd_I fcap_out[0]",
  198554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  198555. }
  198556. },
  198557. "phy_I.bit[3].isd_I.fcap_out[1]": {
  198558. "hide_name": 0,
  198559. "bits": [ "0", "0", "0", "0" ],
  198560. "attributes": {
  198561. "hdlname": "phy_I bit[3].isd_I fcap_out[1]",
  198562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:47.13-47.21"
  198563. }
  198564. },
  198565. "phy_I.bit[3].isd_I.genblk1[0].fp.din": {
  198566. "hide_name": 0,
  198567. "bits": [ 5896 ],
  198568. "attributes": {
  198569. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.din",
  198570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:66.10-66.13"
  198571. }
  198572. },
  198573. "phy_I.bit[3].isd_I.genblk1[0].fp.edge_active": {
  198574. "hide_name": 0,
  198575. "bits": [ "1" ],
  198576. "attributes": {
  198577. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.edge_active",
  198578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:64.10-64.21"
  198579. }
  198580. },
  198581. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.c": {
  198582. "hide_name": 0,
  198583. "bits": [ 5666 ],
  198584. "attributes": {
  198585. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[0].dff_shift_I c",
  198586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198587. }
  198588. },
  198589. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.d": {
  198590. "hide_name": 0,
  198591. "bits": [ 5896 ],
  198592. "attributes": {
  198593. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[0].dff_shift_I d",
  198594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198595. }
  198596. },
  198597. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[0].dff_shift_I.q": {
  198598. "hide_name": 0,
  198599. "bits": [ 5897 ],
  198600. "attributes": {
  198601. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[0].dff_shift_I q",
  198602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198603. }
  198604. },
  198605. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.c": {
  198606. "hide_name": 0,
  198607. "bits": [ 5666 ],
  198608. "attributes": {
  198609. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[1].dff_shift_I c",
  198610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198611. }
  198612. },
  198613. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.d": {
  198614. "hide_name": 0,
  198615. "bits": [ 5897 ],
  198616. "attributes": {
  198617. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[1].dff_shift_I d",
  198618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198619. }
  198620. },
  198621. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[1].dff_shift_I.q": {
  198622. "hide_name": 0,
  198623. "bits": [ 5898 ],
  198624. "attributes": {
  198625. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[1].dff_shift_I q",
  198626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198627. }
  198628. },
  198629. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.c": {
  198630. "hide_name": 0,
  198631. "bits": [ 5666 ],
  198632. "attributes": {
  198633. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[2].dff_shift_I c",
  198634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198635. }
  198636. },
  198637. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.d": {
  198638. "hide_name": 0,
  198639. "bits": [ 5898 ],
  198640. "attributes": {
  198641. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[2].dff_shift_I d",
  198642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198643. }
  198644. },
  198645. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[2].dff_shift_I.q": {
  198646. "hide_name": 0,
  198647. "bits": [ 5899 ],
  198648. "attributes": {
  198649. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[2].dff_shift_I q",
  198650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198651. }
  198652. },
  198653. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.c": {
  198654. "hide_name": 0,
  198655. "bits": [ 5666 ],
  198656. "attributes": {
  198657. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[3].dff_shift_I c",
  198658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198659. }
  198660. },
  198661. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.d": {
  198662. "hide_name": 0,
  198663. "bits": [ 5899 ],
  198664. "attributes": {
  198665. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[3].dff_shift_I d",
  198666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198667. }
  198668. },
  198669. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk2[3].dff_shift_I.q": {
  198670. "hide_name": 0,
  198671. "bits": [ 5900 ],
  198672. "attributes": {
  198673. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk2[3].dff_shift_I q",
  198674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198675. }
  198676. },
  198677. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.c": {
  198678. "hide_name": 0,
  198679. "bits": [ 5666 ],
  198680. "attributes": {
  198681. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[0].dff_shift_I c",
  198682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198683. }
  198684. },
  198685. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.d": {
  198686. "hide_name": 0,
  198687. "bits": [ 5897 ],
  198688. "attributes": {
  198689. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[0].dff_shift_I d",
  198690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198691. }
  198692. },
  198693. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.e": {
  198694. "hide_name": 0,
  198695. "bits": [ 5672 ],
  198696. "attributes": {
  198697. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[0].dff_shift_I e",
  198698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  198699. }
  198700. },
  198701. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[0].dff_shift_I.q": {
  198702. "hide_name": 0,
  198703. "bits": [ 5901 ],
  198704. "attributes": {
  198705. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[0].dff_shift_I q",
  198706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198707. }
  198708. },
  198709. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.c": {
  198710. "hide_name": 0,
  198711. "bits": [ 5666 ],
  198712. "attributes": {
  198713. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[1].dff_shift_I c",
  198714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198715. }
  198716. },
  198717. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.d": {
  198718. "hide_name": 0,
  198719. "bits": [ 5898 ],
  198720. "attributes": {
  198721. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[1].dff_shift_I d",
  198722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198723. }
  198724. },
  198725. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.e": {
  198726. "hide_name": 0,
  198727. "bits": [ 5672 ],
  198728. "attributes": {
  198729. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[1].dff_shift_I e",
  198730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  198731. }
  198732. },
  198733. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[1].dff_shift_I.q": {
  198734. "hide_name": 0,
  198735. "bits": [ 5902 ],
  198736. "attributes": {
  198737. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[1].dff_shift_I q",
  198738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198739. }
  198740. },
  198741. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.c": {
  198742. "hide_name": 0,
  198743. "bits": [ 5666 ],
  198744. "attributes": {
  198745. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[2].dff_shift_I c",
  198746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198747. }
  198748. },
  198749. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.d": {
  198750. "hide_name": 0,
  198751. "bits": [ 5899 ],
  198752. "attributes": {
  198753. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[2].dff_shift_I d",
  198754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198755. }
  198756. },
  198757. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.e": {
  198758. "hide_name": 0,
  198759. "bits": [ 5672 ],
  198760. "attributes": {
  198761. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[2].dff_shift_I e",
  198762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  198763. }
  198764. },
  198765. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[2].dff_shift_I.q": {
  198766. "hide_name": 0,
  198767. "bits": [ 5903 ],
  198768. "attributes": {
  198769. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[2].dff_shift_I q",
  198770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198771. }
  198772. },
  198773. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.c": {
  198774. "hide_name": 0,
  198775. "bits": [ 5666 ],
  198776. "attributes": {
  198777. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[3].dff_shift_I c",
  198778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198779. }
  198780. },
  198781. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.d": {
  198782. "hide_name": 0,
  198783. "bits": [ 5900 ],
  198784. "attributes": {
  198785. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[3].dff_shift_I d",
  198786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198787. }
  198788. },
  198789. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.e": {
  198790. "hide_name": 0,
  198791. "bits": [ 5672 ],
  198792. "attributes": {
  198793. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[3].dff_shift_I e",
  198794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:22.14-22.15"
  198795. }
  198796. },
  198797. "phy_I.bit[3].isd_I.genblk1[0].fp.genblk4[3].dff_shift_I.q": {
  198798. "hide_name": 0,
  198799. "bits": [ 5904 ],
  198800. "attributes": {
  198801. "hdlname": "phy_I bit[3].isd_I genblk1[0].fp.genblk4[3].dff_shift_I q",
  198802. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198803. }
  198804. },
  198805. "phy_I.bit[3].isd_I.genblk2.genblk2[0].dff_scap_I.c": {
  198806. "hide_name": 0,
  198807. "bits": [ 42 ],
  198808. "attributes": {
  198809. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[0].dff_scap_I c",
  198810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198811. }
  198812. },
  198813. "phy_I.bit[3].isd_I.genblk2.genblk2[0].dff_scap_I.d": {
  198814. "hide_name": 0,
  198815. "bits": [ 5901 ],
  198816. "attributes": {
  198817. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[0].dff_scap_I d",
  198818. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198819. }
  198820. },
  198821. "phy_I.bit[3].isd_I.genblk2.genblk2[0].dff_scap_I.q": {
  198822. "hide_name": 0,
  198823. "bits": [ 5905 ],
  198824. "attributes": {
  198825. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[0].dff_scap_I q",
  198826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198827. }
  198828. },
  198829. "phy_I.bit[3].isd_I.genblk2.genblk2[1].dff_scap_I.c": {
  198830. "hide_name": 0,
  198831. "bits": [ 42 ],
  198832. "attributes": {
  198833. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[1].dff_scap_I c",
  198834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198835. }
  198836. },
  198837. "phy_I.bit[3].isd_I.genblk2.genblk2[1].dff_scap_I.d": {
  198838. "hide_name": 0,
  198839. "bits": [ 5902 ],
  198840. "attributes": {
  198841. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[1].dff_scap_I d",
  198842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198843. }
  198844. },
  198845. "phy_I.bit[3].isd_I.genblk2.genblk2[1].dff_scap_I.q": {
  198846. "hide_name": 0,
  198847. "bits": [ 5906 ],
  198848. "attributes": {
  198849. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[1].dff_scap_I q",
  198850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198851. }
  198852. },
  198853. "phy_I.bit[3].isd_I.genblk2.genblk2[2].dff_scap_I.c": {
  198854. "hide_name": 0,
  198855. "bits": [ 42 ],
  198856. "attributes": {
  198857. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[2].dff_scap_I c",
  198858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198859. }
  198860. },
  198861. "phy_I.bit[3].isd_I.genblk2.genblk2[2].dff_scap_I.d": {
  198862. "hide_name": 0,
  198863. "bits": [ 5903 ],
  198864. "attributes": {
  198865. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[2].dff_scap_I d",
  198866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198867. }
  198868. },
  198869. "phy_I.bit[3].isd_I.genblk2.genblk2[2].dff_scap_I.q": {
  198870. "hide_name": 0,
  198871. "bits": [ 5907 ],
  198872. "attributes": {
  198873. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[2].dff_scap_I q",
  198874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198875. }
  198876. },
  198877. "phy_I.bit[3].isd_I.genblk2.genblk2[3].dff_scap_I.c": {
  198878. "hide_name": 0,
  198879. "bits": [ 42 ],
  198880. "attributes": {
  198881. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[3].dff_scap_I c",
  198882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198883. }
  198884. },
  198885. "phy_I.bit[3].isd_I.genblk2.genblk2[3].dff_scap_I.d": {
  198886. "hide_name": 0,
  198887. "bits": [ 5904 ],
  198888. "attributes": {
  198889. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[3].dff_scap_I d",
  198890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198891. }
  198892. },
  198893. "phy_I.bit[3].isd_I.genblk2.genblk2[3].dff_scap_I.q": {
  198894. "hide_name": 0,
  198895. "bits": [ 5908 ],
  198896. "attributes": {
  198897. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[3].dff_scap_I q",
  198898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198899. }
  198900. },
  198901. "phy_I.bit[3].isd_I.genblk2.genblk2[4].dff_scap_I.c": {
  198902. "hide_name": 0,
  198903. "bits": [ 42 ],
  198904. "attributes": {
  198905. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[4].dff_scap_I c",
  198906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  198907. }
  198908. },
  198909. "phy_I.bit[3].isd_I.genblk2.genblk2[4].dff_scap_I.d": {
  198910. "hide_name": 0,
  198911. "bits": [ 5905 ],
  198912. "attributes": {
  198913. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[4].dff_scap_I d",
  198914. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  198915. }
  198916. },
  198917. "phy_I.bit[3].isd_I.genblk2.genblk2[4].dff_scap_I.q": {
  198918. "hide_name": 0,
  198919. "bits": [ 5909 ],
  198920. "attributes": {
  198921. "hdlname": "phy_I bit[3].isd_I genblk2.genblk2[4].dff_scap_I q",
  198922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  198923. }
  198924. },
  198925. "phy_I.bit[3].isd_I.genblk2.scap_in": {
  198926. "hide_name": 0,
  198927. "bits": [ 5901, 5902, 5903, 5904, 5905 ],
  198928. "attributes": {
  198929. "hdlname": "phy_I bit[3].isd_I genblk2.scap_in",
  198930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:168.21-168.28"
  198931. }
  198932. },
  198933. "phy_I.bit[3].isd_I.genblk2.scap_out": {
  198934. "hide_name": 0,
  198935. "bits": [ 5905, 5906, 5907, 5908, 5909 ],
  198936. "attributes": {
  198937. "hdlname": "phy_I bit[3].isd_I genblk2.scap_out",
  198938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:169.21-169.29"
  198939. }
  198940. },
  198941. "phy_I.bit[3].isd_I.phase_sel": {
  198942. "hide_name": 0,
  198943. "bits": [ "0", "0" ],
  198944. "attributes": {
  198945. "hdlname": "phy_I bit[3].isd_I phase_sel",
  198946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:21.20-21.29"
  198947. }
  198948. },
  198949. "phy_I.bit[3].isd_I.q": {
  198950. "hide_name": 0,
  198951. "bits": [ 5906, 5907, 5908, 5909 ],
  198952. "attributes": {
  198953. "hdlname": "phy_I bit[3].isd_I q",
  198954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:19.20-19.21"
  198955. }
  198956. },
  198957. "phy_I.bit[3].isd_I.shift_in[0]": {
  198958. "hide_name": 0,
  198959. "bits": [ 5896, 5897, 5898, 5899 ],
  198960. "attributes": {
  198961. "hdlname": "phy_I bit[3].isd_I shift_in[0]",
  198962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:43.13-43.21"
  198963. }
  198964. },
  198965. "phy_I.bit[3].isd_I.shift_out[0]": {
  198966. "hide_name": 0,
  198967. "bits": [ 5897, 5898, 5899, 5900 ],
  198968. "attributes": {
  198969. "hdlname": "phy_I bit[3].isd_I shift_out[0]",
  198970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:44.13-44.22"
  198971. }
  198972. },
  198973. "phy_I.bit[3].isd_I.sync": {
  198974. "hide_name": 0,
  198975. "bits": [ 5672 ],
  198976. "attributes": {
  198977. "hdlname": "phy_I bit[3].isd_I sync",
  198978. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_iserdes.v:22.20-22.24"
  198979. }
  198980. },
  198981. "phy_I.bit[3].osd_o": {
  198982. "hide_name": 0,
  198983. "bits": [ 5933, "0" ],
  198984. "attributes": {
  198985. "hdlname": "phy_I bit[3].osd_o",
  198986. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:58.15-58.20"
  198987. }
  198988. },
  198989. "phy_I.bit[3].osd_o_I.cap_in": {
  198990. "hide_name": 0,
  198991. "bits": [ 5910, 5913, 5919, 5691 ],
  198992. "attributes": {
  198993. "hdlname": "phy_I bit[3].osd_o_I cap_in",
  198994. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  198995. }
  198996. },
  198997. "phy_I.bit[3].osd_o_I.cap_out": {
  198998. "hide_name": 0,
  198999. "bits": [ 5912, 5918, 5924, 5925 ],
  199000. "attributes": {
  199001. "hdlname": "phy_I bit[3].osd_o_I cap_out",
  199002. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  199003. }
  199004. },
  199005. "phy_I.bit[3].osd_o_I.clk_1x": {
  199006. "hide_name": 0,
  199007. "bits": [ 42 ],
  199008. "attributes": {
  199009. "hdlname": "phy_I bit[3].osd_o_I clk_1x",
  199010. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  199011. }
  199012. },
  199013. "phy_I.bit[3].osd_o_I.clk_4x": {
  199014. "hide_name": 0,
  199015. "bits": [ 5666 ],
  199016. "attributes": {
  199017. "hdlname": "phy_I bit[3].osd_o_I clk_4x",
  199018. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  199019. }
  199020. },
  199021. "phy_I.bit[3].osd_o_I.d": {
  199022. "hide_name": 0,
  199023. "bits": [ 5910, 5913, 5919, 5691 ],
  199024. "attributes": {
  199025. "hdlname": "phy_I bit[3].osd_o_I d",
  199026. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  199027. }
  199028. },
  199029. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.c": {
  199030. "hide_name": 0,
  199031. "bits": [ 42 ],
  199032. "attributes": {
  199033. "hdlname": "phy_I bit[3].osd_o_I genblk1[0].dff_cap_I c",
  199034. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199035. }
  199036. },
  199037. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d": {
  199038. "hide_name": 0,
  199039. "bits": [ 5910 ],
  199040. "attributes": {
  199041. "hdlname": "phy_I bit[3].osd_o_I genblk1[0].dff_cap_I d",
  199042. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199043. }
  199044. },
  199045. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O": {
  199046. "hide_name": 0,
  199047. "bits": [ 5845, 5846, 5847 ],
  199048. "attributes": {
  199049. "force_downto": "00000000000000000000000000000001",
  199050. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199051. }
  199052. },
  199053. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.d_SB_LUT4_I1_O_SB_LUT4_O_I1": {
  199054. "hide_name": 0,
  199055. "bits": [ 5578, 5911, 5613, 5418 ],
  199056. "attributes": {
  199057. "force_downto": "00000000000000000000000000000001",
  199058. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199059. }
  199060. },
  199061. "phy_I.bit[3].osd_o_I.genblk1[0].dff_cap_I.q": {
  199062. "hide_name": 0,
  199063. "bits": [ 5912 ],
  199064. "attributes": {
  199065. "hdlname": "phy_I bit[3].osd_o_I genblk1[0].dff_cap_I q",
  199066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199067. }
  199068. },
  199069. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.c": {
  199070. "hide_name": 0,
  199071. "bits": [ 42 ],
  199072. "attributes": {
  199073. "hdlname": "phy_I bit[3].osd_o_I genblk1[1].dff_cap_I c",
  199074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199075. }
  199076. },
  199077. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d": {
  199078. "hide_name": 0,
  199079. "bits": [ 5913 ],
  199080. "attributes": {
  199081. "hdlname": "phy_I bit[3].osd_o_I genblk1[1].dff_cap_I d",
  199082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199083. }
  199084. },
  199085. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_I1": {
  199086. "hide_name": 0,
  199087. "bits": [ 5913, 5914, 5622, 5418 ],
  199088. "attributes": {
  199089. "force_downto": "00000000000000000000000000000001",
  199090. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199091. }
  199092. },
  199093. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.d_SB_LUT4_I0_O": {
  199094. "hide_name": 0,
  199095. "bits": [ 5915, 5916, 5741 ],
  199096. "attributes": {
  199097. "force_downto": "00000000000000000000000000000001",
  199098. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199099. }
  199100. },
  199101. "phy_I.bit[3].osd_o_I.genblk1[1].dff_cap_I.q": {
  199102. "hide_name": 0,
  199103. "bits": [ 5918 ],
  199104. "attributes": {
  199105. "hdlname": "phy_I bit[3].osd_o_I genblk1[1].dff_cap_I q",
  199106. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199107. }
  199108. },
  199109. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.c": {
  199110. "hide_name": 0,
  199111. "bits": [ 42 ],
  199112. "attributes": {
  199113. "hdlname": "phy_I bit[3].osd_o_I genblk1[2].dff_cap_I c",
  199114. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199115. }
  199116. },
  199117. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d": {
  199118. "hide_name": 0,
  199119. "bits": [ 5919 ],
  199120. "attributes": {
  199121. "hdlname": "phy_I bit[3].osd_o_I genblk1[2].dff_cap_I d",
  199122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199123. }
  199124. },
  199125. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O": {
  199126. "hide_name": 0,
  199127. "bits": [ 5852, 5853, 5750 ],
  199128. "attributes": {
  199129. "force_downto": "00000000000000000000000000000001",
  199130. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199131. }
  199132. },
  199133. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3": {
  199134. "hide_name": 0,
  199135. "bits": [ 123, 124, 5419, 5484 ],
  199136. "attributes": {
  199137. "force_downto": "00000000000000000000000000000001",
  199138. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199139. }
  199140. },
  199141. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I2": {
  199142. "hide_name": 0,
  199143. "bits": [ "0", "0", 5921, 5922 ],
  199144. "attributes": {
  199145. "force_downto": "00000000000000000000000000000001",
  199146. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199147. }
  199148. },
  199149. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  199150. "hide_name": 0,
  199151. "bits": [ 5922 ],
  199152. "attributes": {
  199153. "abc9_carry": "00000000000000000000000000000001",
  199154. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  199155. }
  199156. },
  199157. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO": {
  199158. "hide_name": 0,
  199159. "bits": [ 5923 ],
  199160. "attributes": {
  199161. "abc9_carry": "00000000000000000000000000000001",
  199162. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_memctrl.v:0.0-0.0|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  199163. }
  199164. },
  199165. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_1_I3_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  199166. "hide_name": 0,
  199167. "bits": [ 5478, 5479, 5480 ],
  199168. "attributes": {
  199169. "force_downto": "00000000000000000000000000000001",
  199170. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199171. }
  199172. },
  199173. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.d_SB_LUT4_I0_O_SB_LUT4_O_I1": {
  199174. "hide_name": 0,
  199175. "bits": [ 252, 5920, 5418, 122 ],
  199176. "attributes": {
  199177. "force_downto": "00000000000000000000000000000001",
  199178. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  199179. }
  199180. },
  199181. "phy_I.bit[3].osd_o_I.genblk1[2].dff_cap_I.q": {
  199182. "hide_name": 0,
  199183. "bits": [ 5924 ],
  199184. "attributes": {
  199185. "hdlname": "phy_I bit[3].osd_o_I genblk1[2].dff_cap_I q",
  199186. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199187. }
  199188. },
  199189. "phy_I.bit[3].osd_o_I.genblk1[3].dff_cap_I.c": {
  199190. "hide_name": 0,
  199191. "bits": [ 42 ],
  199192. "attributes": {
  199193. "hdlname": "phy_I bit[3].osd_o_I genblk1[3].dff_cap_I c",
  199194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199195. }
  199196. },
  199197. "phy_I.bit[3].osd_o_I.genblk1[3].dff_cap_I.d": {
  199198. "hide_name": 0,
  199199. "bits": [ 5691 ],
  199200. "attributes": {
  199201. "hdlname": "phy_I bit[3].osd_o_I genblk1[3].dff_cap_I d",
  199202. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199203. }
  199204. },
  199205. "phy_I.bit[3].osd_o_I.genblk1[3].dff_cap_I.q": {
  199206. "hide_name": 0,
  199207. "bits": [ 5925 ],
  199208. "attributes": {
  199209. "hdlname": "phy_I bit[3].osd_o_I genblk1[3].dff_cap_I q",
  199210. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199211. }
  199212. },
  199213. "phy_I.bit[3].osd_o_I.genblk2[0].dff_shift_I.c": {
  199214. "hide_name": 0,
  199215. "bits": [ 5666 ],
  199216. "attributes": {
  199217. "hdlname": "phy_I bit[3].osd_o_I genblk2[0].dff_shift_I c",
  199218. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199219. }
  199220. },
  199221. "phy_I.bit[3].osd_o_I.genblk2[0].dff_shift_I.d": {
  199222. "hide_name": 0,
  199223. "bits": [ 5926 ],
  199224. "attributes": {
  199225. "hdlname": "phy_I bit[3].osd_o_I genblk2[0].dff_shift_I d",
  199226. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199227. }
  199228. },
  199229. "phy_I.bit[3].osd_o_I.genblk2[0].dff_shift_I.q": {
  199230. "hide_name": 0,
  199231. "bits": [ 5927 ],
  199232. "attributes": {
  199233. "hdlname": "phy_I bit[3].osd_o_I genblk2[0].dff_shift_I q",
  199234. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199235. }
  199236. },
  199237. "phy_I.bit[3].osd_o_I.genblk2[1].dff_shift_I.c": {
  199238. "hide_name": 0,
  199239. "bits": [ 5666 ],
  199240. "attributes": {
  199241. "hdlname": "phy_I bit[3].osd_o_I genblk2[1].dff_shift_I c",
  199242. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199243. }
  199244. },
  199245. "phy_I.bit[3].osd_o_I.genblk2[1].dff_shift_I.d": {
  199246. "hide_name": 0,
  199247. "bits": [ 5928 ],
  199248. "attributes": {
  199249. "hdlname": "phy_I bit[3].osd_o_I genblk2[1].dff_shift_I d",
  199250. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199251. }
  199252. },
  199253. "phy_I.bit[3].osd_o_I.genblk2[1].dff_shift_I.q": {
  199254. "hide_name": 0,
  199255. "bits": [ 5929 ],
  199256. "attributes": {
  199257. "hdlname": "phy_I bit[3].osd_o_I genblk2[1].dff_shift_I q",
  199258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199259. }
  199260. },
  199261. "phy_I.bit[3].osd_o_I.genblk2[2].dff_shift_I.c": {
  199262. "hide_name": 0,
  199263. "bits": [ 5666 ],
  199264. "attributes": {
  199265. "hdlname": "phy_I bit[3].osd_o_I genblk2[2].dff_shift_I c",
  199266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199267. }
  199268. },
  199269. "phy_I.bit[3].osd_o_I.genblk2[2].dff_shift_I.d": {
  199270. "hide_name": 0,
  199271. "bits": [ 5930 ],
  199272. "attributes": {
  199273. "hdlname": "phy_I bit[3].osd_o_I genblk2[2].dff_shift_I d",
  199274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199275. }
  199276. },
  199277. "phy_I.bit[3].osd_o_I.genblk2[2].dff_shift_I.q": {
  199278. "hide_name": 0,
  199279. "bits": [ 5931 ],
  199280. "attributes": {
  199281. "hdlname": "phy_I bit[3].osd_o_I genblk2[2].dff_shift_I q",
  199282. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199283. }
  199284. },
  199285. "phy_I.bit[3].osd_o_I.genblk2[3].dff_shift_I.c": {
  199286. "hide_name": 0,
  199287. "bits": [ 5666 ],
  199288. "attributes": {
  199289. "hdlname": "phy_I bit[3].osd_o_I genblk2[3].dff_shift_I c",
  199290. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199291. }
  199292. },
  199293. "phy_I.bit[3].osd_o_I.genblk2[3].dff_shift_I.d": {
  199294. "hide_name": 0,
  199295. "bits": [ 5932 ],
  199296. "attributes": {
  199297. "hdlname": "phy_I bit[3].osd_o_I genblk2[3].dff_shift_I d",
  199298. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199299. }
  199300. },
  199301. "phy_I.bit[3].osd_o_I.genblk2[3].dff_shift_I.q": {
  199302. "hide_name": 0,
  199303. "bits": [ 5933 ],
  199304. "attributes": {
  199305. "hdlname": "phy_I bit[3].osd_o_I genblk2[3].dff_shift_I q",
  199306. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199307. }
  199308. },
  199309. "phy_I.bit[3].osd_o_I.q": {
  199310. "hide_name": 0,
  199311. "bits": [ 5933, "0" ],
  199312. "attributes": {
  199313. "hdlname": "phy_I bit[3].osd_o_I q",
  199314. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  199315. }
  199316. },
  199317. "phy_I.bit[3].osd_o_I.shift_in": {
  199318. "hide_name": 0,
  199319. "bits": [ 5926, 5928, 5930, 5932 ],
  199320. "attributes": {
  199321. "hdlname": "phy_I bit[3].osd_o_I shift_in",
  199322. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  199323. }
  199324. },
  199325. "phy_I.bit[3].osd_o_I.shift_out": {
  199326. "hide_name": 0,
  199327. "bits": [ 5927, 5929, 5931, 5933 ],
  199328. "attributes": {
  199329. "hdlname": "phy_I bit[3].osd_o_I shift_out",
  199330. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  199331. }
  199332. },
  199333. "phy_I.bit[3].osd_o_I.sync": {
  199334. "hide_name": 0,
  199335. "bits": [ 5672 ],
  199336. "attributes": {
  199337. "hdlname": "phy_I bit[3].osd_o_I sync",
  199338. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  199339. }
  199340. },
  199341. "phy_I.bit[3].osd_oe": {
  199342. "hide_name": 0,
  199343. "bits": [ 5945, "0" ],
  199344. "attributes": {
  199345. "hdlname": "phy_I bit[3].osd_oe",
  199346. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:59.15-59.21"
  199347. }
  199348. },
  199349. "phy_I.bit[3].osd_oe_I.cap_in": {
  199350. "hide_name": 0,
  199351. "bits": [ 5612, 5612, 5612, 5612 ],
  199352. "attributes": {
  199353. "hdlname": "phy_I bit[3].osd_oe_I cap_in",
  199354. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  199355. }
  199356. },
  199357. "phy_I.bit[3].osd_oe_I.cap_out": {
  199358. "hide_name": 0,
  199359. "bits": [ 5934, 5935, 5936, 5937 ],
  199360. "attributes": {
  199361. "hdlname": "phy_I bit[3].osd_oe_I cap_out",
  199362. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  199363. }
  199364. },
  199365. "phy_I.bit[3].osd_oe_I.clk_1x": {
  199366. "hide_name": 0,
  199367. "bits": [ 42 ],
  199368. "attributes": {
  199369. "hdlname": "phy_I bit[3].osd_oe_I clk_1x",
  199370. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  199371. }
  199372. },
  199373. "phy_I.bit[3].osd_oe_I.clk_4x": {
  199374. "hide_name": 0,
  199375. "bits": [ 5666 ],
  199376. "attributes": {
  199377. "hdlname": "phy_I bit[3].osd_oe_I clk_4x",
  199378. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  199379. }
  199380. },
  199381. "phy_I.bit[3].osd_oe_I.d": {
  199382. "hide_name": 0,
  199383. "bits": [ 5612, 5612, 5612, 5612 ],
  199384. "attributes": {
  199385. "hdlname": "phy_I bit[3].osd_oe_I d",
  199386. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  199387. }
  199388. },
  199389. "phy_I.bit[3].osd_oe_I.genblk1[0].dff_cap_I.c": {
  199390. "hide_name": 0,
  199391. "bits": [ 42 ],
  199392. "attributes": {
  199393. "hdlname": "phy_I bit[3].osd_oe_I genblk1[0].dff_cap_I c",
  199394. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199395. }
  199396. },
  199397. "phy_I.bit[3].osd_oe_I.genblk1[0].dff_cap_I.d": {
  199398. "hide_name": 0,
  199399. "bits": [ 5612 ],
  199400. "attributes": {
  199401. "hdlname": "phy_I bit[3].osd_oe_I genblk1[0].dff_cap_I d",
  199402. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199403. }
  199404. },
  199405. "phy_I.bit[3].osd_oe_I.genblk1[0].dff_cap_I.q": {
  199406. "hide_name": 0,
  199407. "bits": [ 5934 ],
  199408. "attributes": {
  199409. "hdlname": "phy_I bit[3].osd_oe_I genblk1[0].dff_cap_I q",
  199410. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199411. }
  199412. },
  199413. "phy_I.bit[3].osd_oe_I.genblk1[1].dff_cap_I.c": {
  199414. "hide_name": 0,
  199415. "bits": [ 42 ],
  199416. "attributes": {
  199417. "hdlname": "phy_I bit[3].osd_oe_I genblk1[1].dff_cap_I c",
  199418. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199419. }
  199420. },
  199421. "phy_I.bit[3].osd_oe_I.genblk1[1].dff_cap_I.d": {
  199422. "hide_name": 0,
  199423. "bits": [ 5612 ],
  199424. "attributes": {
  199425. "hdlname": "phy_I bit[3].osd_oe_I genblk1[1].dff_cap_I d",
  199426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199427. }
  199428. },
  199429. "phy_I.bit[3].osd_oe_I.genblk1[1].dff_cap_I.q": {
  199430. "hide_name": 0,
  199431. "bits": [ 5935 ],
  199432. "attributes": {
  199433. "hdlname": "phy_I bit[3].osd_oe_I genblk1[1].dff_cap_I q",
  199434. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199435. }
  199436. },
  199437. "phy_I.bit[3].osd_oe_I.genblk1[2].dff_cap_I.c": {
  199438. "hide_name": 0,
  199439. "bits": [ 42 ],
  199440. "attributes": {
  199441. "hdlname": "phy_I bit[3].osd_oe_I genblk1[2].dff_cap_I c",
  199442. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199443. }
  199444. },
  199445. "phy_I.bit[3].osd_oe_I.genblk1[2].dff_cap_I.d": {
  199446. "hide_name": 0,
  199447. "bits": [ 5612 ],
  199448. "attributes": {
  199449. "hdlname": "phy_I bit[3].osd_oe_I genblk1[2].dff_cap_I d",
  199450. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199451. }
  199452. },
  199453. "phy_I.bit[3].osd_oe_I.genblk1[2].dff_cap_I.q": {
  199454. "hide_name": 0,
  199455. "bits": [ 5936 ],
  199456. "attributes": {
  199457. "hdlname": "phy_I bit[3].osd_oe_I genblk1[2].dff_cap_I q",
  199458. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199459. }
  199460. },
  199461. "phy_I.bit[3].osd_oe_I.genblk1[3].dff_cap_I.c": {
  199462. "hide_name": 0,
  199463. "bits": [ 42 ],
  199464. "attributes": {
  199465. "hdlname": "phy_I bit[3].osd_oe_I genblk1[3].dff_cap_I c",
  199466. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199467. }
  199468. },
  199469. "phy_I.bit[3].osd_oe_I.genblk1[3].dff_cap_I.d": {
  199470. "hide_name": 0,
  199471. "bits": [ 5612 ],
  199472. "attributes": {
  199473. "hdlname": "phy_I bit[3].osd_oe_I genblk1[3].dff_cap_I d",
  199474. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199475. }
  199476. },
  199477. "phy_I.bit[3].osd_oe_I.genblk1[3].dff_cap_I.q": {
  199478. "hide_name": 0,
  199479. "bits": [ 5937 ],
  199480. "attributes": {
  199481. "hdlname": "phy_I bit[3].osd_oe_I genblk1[3].dff_cap_I q",
  199482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199483. }
  199484. },
  199485. "phy_I.bit[3].osd_oe_I.genblk2[0].dff_shift_I.c": {
  199486. "hide_name": 0,
  199487. "bits": [ 5666 ],
  199488. "attributes": {
  199489. "hdlname": "phy_I bit[3].osd_oe_I genblk2[0].dff_shift_I c",
  199490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199491. }
  199492. },
  199493. "phy_I.bit[3].osd_oe_I.genblk2[0].dff_shift_I.d": {
  199494. "hide_name": 0,
  199495. "bits": [ 5938 ],
  199496. "attributes": {
  199497. "hdlname": "phy_I bit[3].osd_oe_I genblk2[0].dff_shift_I d",
  199498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199499. }
  199500. },
  199501. "phy_I.bit[3].osd_oe_I.genblk2[0].dff_shift_I.q": {
  199502. "hide_name": 0,
  199503. "bits": [ 5939 ],
  199504. "attributes": {
  199505. "hdlname": "phy_I bit[3].osd_oe_I genblk2[0].dff_shift_I q",
  199506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199507. }
  199508. },
  199509. "phy_I.bit[3].osd_oe_I.genblk2[1].dff_shift_I.c": {
  199510. "hide_name": 0,
  199511. "bits": [ 5666 ],
  199512. "attributes": {
  199513. "hdlname": "phy_I bit[3].osd_oe_I genblk2[1].dff_shift_I c",
  199514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199515. }
  199516. },
  199517. "phy_I.bit[3].osd_oe_I.genblk2[1].dff_shift_I.d": {
  199518. "hide_name": 0,
  199519. "bits": [ 5940 ],
  199520. "attributes": {
  199521. "hdlname": "phy_I bit[3].osd_oe_I genblk2[1].dff_shift_I d",
  199522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199523. }
  199524. },
  199525. "phy_I.bit[3].osd_oe_I.genblk2[1].dff_shift_I.q": {
  199526. "hide_name": 0,
  199527. "bits": [ 5941 ],
  199528. "attributes": {
  199529. "hdlname": "phy_I bit[3].osd_oe_I genblk2[1].dff_shift_I q",
  199530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199531. }
  199532. },
  199533. "phy_I.bit[3].osd_oe_I.genblk2[2].dff_shift_I.c": {
  199534. "hide_name": 0,
  199535. "bits": [ 5666 ],
  199536. "attributes": {
  199537. "hdlname": "phy_I bit[3].osd_oe_I genblk2[2].dff_shift_I c",
  199538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199539. }
  199540. },
  199541. "phy_I.bit[3].osd_oe_I.genblk2[2].dff_shift_I.d": {
  199542. "hide_name": 0,
  199543. "bits": [ 5942 ],
  199544. "attributes": {
  199545. "hdlname": "phy_I bit[3].osd_oe_I genblk2[2].dff_shift_I d",
  199546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199547. }
  199548. },
  199549. "phy_I.bit[3].osd_oe_I.genblk2[2].dff_shift_I.q": {
  199550. "hide_name": 0,
  199551. "bits": [ 5943 ],
  199552. "attributes": {
  199553. "hdlname": "phy_I bit[3].osd_oe_I genblk2[2].dff_shift_I q",
  199554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199555. }
  199556. },
  199557. "phy_I.bit[3].osd_oe_I.genblk2[3].dff_shift_I.c": {
  199558. "hide_name": 0,
  199559. "bits": [ 5666 ],
  199560. "attributes": {
  199561. "hdlname": "phy_I bit[3].osd_oe_I genblk2[3].dff_shift_I c",
  199562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199563. }
  199564. },
  199565. "phy_I.bit[3].osd_oe_I.genblk2[3].dff_shift_I.d": {
  199566. "hide_name": 0,
  199567. "bits": [ 5944 ],
  199568. "attributes": {
  199569. "hdlname": "phy_I bit[3].osd_oe_I genblk2[3].dff_shift_I d",
  199570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199571. }
  199572. },
  199573. "phy_I.bit[3].osd_oe_I.genblk2[3].dff_shift_I.q": {
  199574. "hide_name": 0,
  199575. "bits": [ 5945 ],
  199576. "attributes": {
  199577. "hdlname": "phy_I bit[3].osd_oe_I genblk2[3].dff_shift_I q",
  199578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199579. }
  199580. },
  199581. "phy_I.bit[3].osd_oe_I.q": {
  199582. "hide_name": 0,
  199583. "bits": [ 5945, "0" ],
  199584. "attributes": {
  199585. "hdlname": "phy_I bit[3].osd_oe_I q",
  199586. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  199587. }
  199588. },
  199589. "phy_I.bit[3].osd_oe_I.shift_in": {
  199590. "hide_name": 0,
  199591. "bits": [ 5938, 5940, 5942, 5944 ],
  199592. "attributes": {
  199593. "hdlname": "phy_I bit[3].osd_oe_I shift_in",
  199594. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  199595. }
  199596. },
  199597. "phy_I.bit[3].osd_oe_I.shift_out": {
  199598. "hide_name": 0,
  199599. "bits": [ 5939, 5941, 5943, 5945 ],
  199600. "attributes": {
  199601. "hdlname": "phy_I bit[3].osd_oe_I shift_out",
  199602. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  199603. }
  199604. },
  199605. "phy_I.bit[3].osd_oe_I.sync": {
  199606. "hide_name": 0,
  199607. "bits": [ 5672 ],
  199608. "attributes": {
  199609. "hdlname": "phy_I bit[3].osd_oe_I sync",
  199610. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  199611. }
  199612. },
  199613. "phy_I.clk_1x": {
  199614. "hide_name": 0,
  199615. "bits": [ 42 ],
  199616. "attributes": {
  199617. "hdlname": "phy_I clk_1x",
  199618. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:33.14-33.20"
  199619. }
  199620. },
  199621. "phy_I.clk_4x": {
  199622. "hide_name": 0,
  199623. "bits": [ 5666 ],
  199624. "attributes": {
  199625. "hdlname": "phy_I clk_4x",
  199626. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:34.14-34.20"
  199627. }
  199628. },
  199629. "phy_I.clk_sync": {
  199630. "hide_name": 0,
  199631. "bits": [ 5672 ],
  199632. "attributes": {
  199633. "hdlname": "phy_I clk_sync",
  199634. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:35.14-35.22"
  199635. }
  199636. },
  199637. "phy_I.genblk2.osd_clk_I.cap_in": {
  199638. "hide_name": 0,
  199639. "bits": [ 5947, 5947, 5461, 5461 ],
  199640. "attributes": {
  199641. "hdlname": "phy_I genblk2.osd_clk_I cap_in",
  199642. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:29.13-29.19"
  199643. }
  199644. },
  199645. "phy_I.genblk2.osd_clk_I.cap_out": {
  199646. "hide_name": 0,
  199647. "bits": [ 5948, 5949, 5950, 5951 ],
  199648. "attributes": {
  199649. "hdlname": "phy_I genblk2.osd_clk_I cap_out",
  199650. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:30.13-30.20"
  199651. }
  199652. },
  199653. "phy_I.genblk2.osd_clk_I.clk_1x": {
  199654. "hide_name": 0,
  199655. "bits": [ 42 ],
  199656. "attributes": {
  199657. "hdlname": "phy_I genblk2.osd_clk_I clk_1x",
  199658. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:19.20-19.26"
  199659. }
  199660. },
  199661. "phy_I.genblk2.osd_clk_I.clk_4x": {
  199662. "hide_name": 0,
  199663. "bits": [ 5666 ],
  199664. "attributes": {
  199665. "hdlname": "phy_I genblk2.osd_clk_I clk_4x",
  199666. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:20.20-20.26"
  199667. }
  199668. },
  199669. "phy_I.genblk2.osd_clk_I.d": {
  199670. "hide_name": 0,
  199671. "bits": [ 5947, 5947, 5461, 5461 ],
  199672. "attributes": {
  199673. "hdlname": "phy_I genblk2.osd_clk_I d",
  199674. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:16.20-16.21"
  199675. }
  199676. },
  199677. "phy_I.genblk2.osd_clk_I.delay_out": {
  199678. "hide_name": 0,
  199679. "bits": [ 5946 ],
  199680. "attributes": {
  199681. "hdlname": "phy_I genblk2.osd_clk_I delay_out",
  199682. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:35.13-35.22"
  199683. }
  199684. },
  199685. "phy_I.genblk2.osd_clk_I.genblk1[0].dff_cap_I.c": {
  199686. "hide_name": 0,
  199687. "bits": [ 42 ],
  199688. "attributes": {
  199689. "hdlname": "phy_I genblk2.osd_clk_I genblk1[0].dff_cap_I c",
  199690. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199691. }
  199692. },
  199693. "phy_I.genblk2.osd_clk_I.genblk1[0].dff_cap_I.d": {
  199694. "hide_name": 0,
  199695. "bits": [ 5947 ],
  199696. "attributes": {
  199697. "hdlname": "phy_I genblk2.osd_clk_I genblk1[0].dff_cap_I d",
  199698. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199699. }
  199700. },
  199701. "phy_I.genblk2.osd_clk_I.genblk1[0].dff_cap_I.q": {
  199702. "hide_name": 0,
  199703. "bits": [ 5948 ],
  199704. "attributes": {
  199705. "hdlname": "phy_I genblk2.osd_clk_I genblk1[0].dff_cap_I q",
  199706. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199707. }
  199708. },
  199709. "phy_I.genblk2.osd_clk_I.genblk1[1].dff_cap_I.c": {
  199710. "hide_name": 0,
  199711. "bits": [ 42 ],
  199712. "attributes": {
  199713. "hdlname": "phy_I genblk2.osd_clk_I genblk1[1].dff_cap_I c",
  199714. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199715. }
  199716. },
  199717. "phy_I.genblk2.osd_clk_I.genblk1[1].dff_cap_I.d": {
  199718. "hide_name": 0,
  199719. "bits": [ 5947 ],
  199720. "attributes": {
  199721. "hdlname": "phy_I genblk2.osd_clk_I genblk1[1].dff_cap_I d",
  199722. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199723. }
  199724. },
  199725. "phy_I.genblk2.osd_clk_I.genblk1[1].dff_cap_I.q": {
  199726. "hide_name": 0,
  199727. "bits": [ 5949 ],
  199728. "attributes": {
  199729. "hdlname": "phy_I genblk2.osd_clk_I genblk1[1].dff_cap_I q",
  199730. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199731. }
  199732. },
  199733. "phy_I.genblk2.osd_clk_I.genblk1[2].dff_cap_I.c": {
  199734. "hide_name": 0,
  199735. "bits": [ 42 ],
  199736. "attributes": {
  199737. "hdlname": "phy_I genblk2.osd_clk_I genblk1[2].dff_cap_I c",
  199738. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199739. }
  199740. },
  199741. "phy_I.genblk2.osd_clk_I.genblk1[2].dff_cap_I.d": {
  199742. "hide_name": 0,
  199743. "bits": [ 5461 ],
  199744. "attributes": {
  199745. "hdlname": "phy_I genblk2.osd_clk_I genblk1[2].dff_cap_I d",
  199746. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199747. }
  199748. },
  199749. "phy_I.genblk2.osd_clk_I.genblk1[2].dff_cap_I.q": {
  199750. "hide_name": 0,
  199751. "bits": [ 5950 ],
  199752. "attributes": {
  199753. "hdlname": "phy_I genblk2.osd_clk_I genblk1[2].dff_cap_I q",
  199754. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199755. }
  199756. },
  199757. "phy_I.genblk2.osd_clk_I.genblk1[3].dff_cap_I.c": {
  199758. "hide_name": 0,
  199759. "bits": [ 42 ],
  199760. "attributes": {
  199761. "hdlname": "phy_I genblk2.osd_clk_I genblk1[3].dff_cap_I c",
  199762. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199763. }
  199764. },
  199765. "phy_I.genblk2.osd_clk_I.genblk1[3].dff_cap_I.d": {
  199766. "hide_name": 0,
  199767. "bits": [ 5461 ],
  199768. "attributes": {
  199769. "hdlname": "phy_I genblk2.osd_clk_I genblk1[3].dff_cap_I d",
  199770. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199771. }
  199772. },
  199773. "phy_I.genblk2.osd_clk_I.genblk1[3].dff_cap_I.q": {
  199774. "hide_name": 0,
  199775. "bits": [ 5951 ],
  199776. "attributes": {
  199777. "hdlname": "phy_I genblk2.osd_clk_I genblk1[3].dff_cap_I q",
  199778. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199779. }
  199780. },
  199781. "phy_I.genblk2.osd_clk_I.genblk2[0].dff_shift_I.c": {
  199782. "hide_name": 0,
  199783. "bits": [ 5666 ],
  199784. "attributes": {
  199785. "hdlname": "phy_I genblk2.osd_clk_I genblk2[0].dff_shift_I c",
  199786. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199787. }
  199788. },
  199789. "phy_I.genblk2.osd_clk_I.genblk2[0].dff_shift_I.d": {
  199790. "hide_name": 0,
  199791. "bits": [ 5952 ],
  199792. "attributes": {
  199793. "hdlname": "phy_I genblk2.osd_clk_I genblk2[0].dff_shift_I d",
  199794. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199795. }
  199796. },
  199797. "phy_I.genblk2.osd_clk_I.genblk2[0].dff_shift_I.q": {
  199798. "hide_name": 0,
  199799. "bits": [ 5953 ],
  199800. "attributes": {
  199801. "hdlname": "phy_I genblk2.osd_clk_I genblk2[0].dff_shift_I q",
  199802. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199803. }
  199804. },
  199805. "phy_I.genblk2.osd_clk_I.genblk2[1].dff_shift_I.c": {
  199806. "hide_name": 0,
  199807. "bits": [ 5666 ],
  199808. "attributes": {
  199809. "hdlname": "phy_I genblk2.osd_clk_I genblk2[1].dff_shift_I c",
  199810. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199811. }
  199812. },
  199813. "phy_I.genblk2.osd_clk_I.genblk2[1].dff_shift_I.d": {
  199814. "hide_name": 0,
  199815. "bits": [ 5954 ],
  199816. "attributes": {
  199817. "hdlname": "phy_I genblk2.osd_clk_I genblk2[1].dff_shift_I d",
  199818. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199819. }
  199820. },
  199821. "phy_I.genblk2.osd_clk_I.genblk2[1].dff_shift_I.q": {
  199822. "hide_name": 0,
  199823. "bits": [ 5955 ],
  199824. "attributes": {
  199825. "hdlname": "phy_I genblk2.osd_clk_I genblk2[1].dff_shift_I q",
  199826. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199827. }
  199828. },
  199829. "phy_I.genblk2.osd_clk_I.genblk2[2].dff_shift_I.c": {
  199830. "hide_name": 0,
  199831. "bits": [ 5666 ],
  199832. "attributes": {
  199833. "hdlname": "phy_I genblk2.osd_clk_I genblk2[2].dff_shift_I c",
  199834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199835. }
  199836. },
  199837. "phy_I.genblk2.osd_clk_I.genblk2[2].dff_shift_I.d": {
  199838. "hide_name": 0,
  199839. "bits": [ 5956 ],
  199840. "attributes": {
  199841. "hdlname": "phy_I genblk2.osd_clk_I genblk2[2].dff_shift_I d",
  199842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199843. }
  199844. },
  199845. "phy_I.genblk2.osd_clk_I.genblk2[2].dff_shift_I.q": {
  199846. "hide_name": 0,
  199847. "bits": [ 5957 ],
  199848. "attributes": {
  199849. "hdlname": "phy_I genblk2.osd_clk_I genblk2[2].dff_shift_I q",
  199850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199851. }
  199852. },
  199853. "phy_I.genblk2.osd_clk_I.genblk2[3].dff_shift_I.c": {
  199854. "hide_name": 0,
  199855. "bits": [ 5666 ],
  199856. "attributes": {
  199857. "hdlname": "phy_I genblk2.osd_clk_I genblk2[3].dff_shift_I c",
  199858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199859. }
  199860. },
  199861. "phy_I.genblk2.osd_clk_I.genblk2[3].dff_shift_I.d": {
  199862. "hide_name": 0,
  199863. "bits": [ 5958 ],
  199864. "attributes": {
  199865. "hdlname": "phy_I genblk2.osd_clk_I genblk2[3].dff_shift_I d",
  199866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199867. }
  199868. },
  199869. "phy_I.genblk2.osd_clk_I.genblk2[3].dff_shift_I.q": {
  199870. "hide_name": 0,
  199871. "bits": [ 5959 ],
  199872. "attributes": {
  199873. "hdlname": "phy_I genblk2.osd_clk_I genblk2[3].dff_shift_I q",
  199874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199875. }
  199876. },
  199877. "phy_I.genblk2.osd_clk_I.genblk3.dff_out_I.c": {
  199878. "hide_name": 0,
  199879. "bits": [ 5666 ],
  199880. "attributes": {
  199881. "hdlname": "phy_I genblk2.osd_clk_I genblk3.dff_out_I c",
  199882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  199883. }
  199884. },
  199885. "phy_I.genblk2.osd_clk_I.genblk3.dff_out_I.d": {
  199886. "hide_name": 0,
  199887. "bits": [ 5959 ],
  199888. "attributes": {
  199889. "hdlname": "phy_I genblk2.osd_clk_I genblk3.dff_out_I d",
  199890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  199891. }
  199892. },
  199893. "phy_I.genblk2.osd_clk_I.genblk3.dff_out_I.q": {
  199894. "hide_name": 0,
  199895. "bits": [ 5946 ],
  199896. "attributes": {
  199897. "hdlname": "phy_I genblk2.osd_clk_I genblk3.dff_out_I q",
  199898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  199899. }
  199900. },
  199901. "phy_I.genblk2.osd_clk_I.q": {
  199902. "hide_name": 0,
  199903. "bits": [ "0", 5946 ],
  199904. "attributes": {
  199905. "hdlname": "phy_I genblk2.osd_clk_I q",
  199906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:17.20-17.21"
  199907. }
  199908. },
  199909. "phy_I.genblk2.osd_clk_I.shift_in": {
  199910. "hide_name": 0,
  199911. "bits": [ 5952, 5954, 5956, 5958 ],
  199912. "attributes": {
  199913. "hdlname": "phy_I genblk2.osd_clk_I shift_in",
  199914. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:32.13-32.21"
  199915. }
  199916. },
  199917. "phy_I.genblk2.osd_clk_I.shift_out": {
  199918. "hide_name": 0,
  199919. "bits": [ 5953, 5955, 5957, 5959 ],
  199920. "attributes": {
  199921. "hdlname": "phy_I genblk2.osd_clk_I shift_out",
  199922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:33.13-33.22"
  199923. }
  199924. },
  199925. "phy_I.genblk2.osd_clk_I.sync": {
  199926. "hide_name": 0,
  199927. "bits": [ 5672 ],
  199928. "attributes": {
  199929. "hdlname": "phy_I genblk2.osd_clk_I sync",
  199930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_oserdes.v:18.20-18.24"
  199931. }
  199932. },
  199933. "phy_I.iob_clk": {
  199934. "hide_name": 0,
  199935. "bits": [ "0", 5946 ],
  199936. "attributes": {
  199937. "hdlname": "phy_I iob_clk",
  199938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:40.14-40.21"
  199939. }
  199940. },
  199941. "phy_I.iob_cs_o": {
  199942. "hide_name": 0,
  199943. "bits": [ 5960, 5961 ],
  199944. "attributes": {
  199945. "hdlname": "phy_I iob_cs_o",
  199946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:44.14-44.22"
  199947. }
  199948. },
  199949. "phy_I.iob_io_i": {
  199950. "hide_name": 0,
  199951. "bits": [ 5667, 5715, 5775, 5896 ],
  199952. "attributes": {
  199953. "hdlname": "phy_I iob_io_i",
  199954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:43.14-43.22"
  199955. }
  199956. },
  199957. "phy_I.iob_io_i_ne": {
  199958. "hide_name": 0,
  199959. "bits": [ 5667, 5715, 5775, 5896 ],
  199960. "attributes": {
  199961. "hdlname": "phy_I iob_io_i_ne",
  199962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:46.14-46.25"
  199963. }
  199964. },
  199965. "phy_I.iob_io_i_pe": {
  199966. "hide_name": 0,
  199967. "bits": [ 5962, 5963, 5964, 5965 ],
  199968. "attributes": {
  199969. "hdlname": "phy_I iob_io_i_pe",
  199970. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:47.14-47.25",
  199971. "unused_bits": "0 1 2 3"
  199972. }
  199973. },
  199974. "phy_I.iob_io_o": {
  199975. "hide_name": 0,
  199976. "bits": [ 5701, 5762, 5883, 5933 ],
  199977. "attributes": {
  199978. "hdlname": "phy_I iob_io_o",
  199979. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:42.14-42.22"
  199980. }
  199981. },
  199982. "phy_I.iob_io_oe": {
  199983. "hide_name": 0,
  199984. "bits": [ 5714, 5774, 5895, 5945 ],
  199985. "attributes": {
  199986. "hdlname": "phy_I iob_io_oe",
  199987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:41.14-41.23"
  199988. }
  199989. },
  199990. "phy_I.pad_clk": {
  199991. "hide_name": 0,
  199992. "bits": [ 6 ],
  199993. "attributes": {
  199994. "hdlname": "phy_I pad_clk",
  199995. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:22.21-22.28",
  199996. "unused_bits": "0 "
  199997. }
  199998. },
  199999. "phy_I.pad_cs_n": {
  200000. "hide_name": 0,
  200001. "bits": [ 7, 8 ],
  200002. "attributes": {
  200003. "hdlname": "phy_I pad_cs_n",
  200004. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:23.21-23.29",
  200005. "unused_bits": "0 1"
  200006. }
  200007. },
  200008. "phy_I.pad_io": {
  200009. "hide_name": 0,
  200010. "bits": [ 2, 3, 4, 5 ],
  200011. "attributes": {
  200012. "hdlname": "phy_I pad_io",
  200013. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:21.21-21.27",
  200014. "unused_bits": "0 1 2 3"
  200015. }
  200016. },
  200017. "phy_I.phy_clk_o": {
  200018. "hide_name": 0,
  200019. "bits": [ 5947, 5947, 5461, 5461 ],
  200020. "attributes": {
  200021. "hdlname": "phy_I phy_clk_o",
  200022. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:29.21-29.30"
  200023. }
  200024. },
  200025. "phy_I.phy_cs_o": {
  200026. "hide_name": 0,
  200027. "bits": [ 5478, 5476 ],
  200028. "attributes": {
  200029. "hdlname": "phy_I phy_cs_o",
  200030. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:30.21-30.29"
  200031. }
  200032. },
  200033. "phy_I.phy_io_i": {
  200034. "hide_name": 0,
  200035. "bits": [ 5678, 5680, 5681, 5682, 5679, 5725, 5726, 5727, 5785, 5786, 5787, 5788, 5906, 5907, 5908, 5909 ],
  200036. "attributes": {
  200037. "hdlname": "phy_I phy_io_i",
  200038. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:26.21-26.29"
  200039. }
  200040. },
  200041. "phy_I.phy_io_o": {
  200042. "hide_name": 0,
  200043. "bits": [ 5683, 5686, 5689, 5692, 5729, 5736, 5747, 5685, 5790, 5798, 5804, 5688, 5910, 5913, 5919, 5691 ],
  200044. "attributes": {
  200045. "hdlname": "phy_I phy_io_o",
  200046. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:27.21-27.29"
  200047. }
  200048. },
  200049. "phy_I.phy_io_oe": {
  200050. "hide_name": 0,
  200051. "bits": [ 5702, 5612, 5612, 5612 ],
  200052. "attributes": {
  200053. "hdlname": "phy_I phy_io_oe",
  200054. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2qpimem//rtl/qpi_phy_ice40_4x.v:28.21-28.30"
  200055. }
  200056. },
  200057. "phy_clk_o": {
  200058. "hide_name": 0,
  200059. "bits": [ 5947, 5947, 5461, 5461 ],
  200060. "attributes": {
  200061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:125.14-125.23"
  200062. }
  200063. },
  200064. "phy_cs_o": {
  200065. "hide_name": 0,
  200066. "bits": [ 5478, 5476 ],
  200067. "attributes": {
  200068. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:126.14-126.22"
  200069. }
  200070. },
  200071. "phy_io_i": {
  200072. "hide_name": 0,
  200073. "bits": [ 5678, 5680, 5681, 5682, 5679, 5725, 5726, 5727, 5785, 5786, 5787, 5788, 5906, 5907, 5908, 5909 ],
  200074. "attributes": {
  200075. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:122.14-122.22"
  200076. }
  200077. },
  200078. "phy_io_o": {
  200079. "hide_name": 0,
  200080. "bits": [ 5683, 5686, 5689, 5692, 5729, 5736, 5747, 5685, 5790, 5798, 5804, 5688, 5910, 5913, 5919, 5691 ],
  200081. "attributes": {
  200082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:123.14-123.22"
  200083. }
  200084. },
  200085. "phy_io_oe": {
  200086. "hide_name": 0,
  200087. "bits": [ 5702, 5612, 5612, 5612 ],
  200088. "attributes": {
  200089. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:124.14-124.23"
  200090. }
  200091. },
  200092. "ram_addr": {
  200093. "hide_name": 0,
  200094. "bits": [ 34, 35, 36, 37, 38, 39, 40, 41, 396, 397, 398, 399, 673, 672, 681, 680, 679, 678, 677, 676, 675, 674, 671, 670, "x", "x", "x", "x" ],
  200095. "attributes": {
  200096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:87.14-87.22"
  200097. }
  200098. },
  200099. "ram_rdata": {
  200100. "hide_name": 0,
  200101. "bits": [ 43, 51, 47, 55, 45, 53, 49, 57, 44, 52, 48, 56, 46, 54, 50, 58, 78, 86, 82, 90, 80, 88, 84, 92, 79, 87, 83, 91, 81, 89, 85, 93 ],
  200102. "attributes": {
  200103. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:88.14-88.23"
  200104. }
  200105. },
  200106. "ram_wdata": {
  200107. "hide_name": 0,
  200108. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  200109. "attributes": {
  200110. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:89.14-89.23"
  200111. }
  200112. },
  200113. "rgb": {
  200114. "hide_name": 0,
  200115. "bits": [ 28, 29, 30 ],
  200116. "attributes": {
  200117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:35.20-35.23"
  200118. }
  200119. },
  200120. "rgb_I.clk": {
  200121. "hide_name": 0,
  200122. "bits": [ 42 ],
  200123. "attributes": {
  200124. "hdlname": "rgb_I clk",
  200125. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:33.14-33.17"
  200126. }
  200127. },
  200128. "rgb_I.led_I_LEDDCS": {
  200129. "hide_name": 0,
  200130. "bits": [ 5386, 5387, 5388 ],
  200131. "attributes": {
  200132. "force_downto": "00000000000000000000000000000001",
  200133. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200134. }
  200135. },
  200136. "rgb_I.led_ctrl": {
  200137. "hide_name": 0,
  200138. "bits": [ "x", 5967, 5974, 5972, "x" ],
  200139. "attributes": {
  200140. "hdlname": "rgb_I led_ctrl",
  200141. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:40.13-40.21"
  200142. }
  200143. },
  200144. "rgb_I.led_ctrl_SB_DFFR_Q_1_D": {
  200145. "hide_name": 0,
  200146. "bits": [ 5973 ],
  200147. "attributes": {
  200148. }
  200149. },
  200150. "rgb_I.led_ctrl_SB_DFFR_Q_2_D": {
  200151. "hide_name": 0,
  200152. "bits": [ 5976 ],
  200153. "attributes": {
  200154. }
  200155. },
  200156. "rgb_I.led_ctrl_SB_DFFR_Q_D": {
  200157. "hide_name": 0,
  200158. "bits": [ 5971 ],
  200159. "attributes": {
  200160. }
  200161. },
  200162. "rgb_I.pad_rgb": {
  200163. "hide_name": 0,
  200164. "bits": [ 28, 29, 30 ],
  200165. "attributes": {
  200166. "hdlname": "rgb_I pad_rgb",
  200167. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:22.21-22.28"
  200168. }
  200169. },
  200170. "rgb_I.pwm_rgb": {
  200171. "hide_name": 0,
  200172. "bits": [ 5968, 5969, 5970 ],
  200173. "attributes": {
  200174. "hdlname": "rgb_I pwm_rgb",
  200175. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:41.13-41.20"
  200176. }
  200177. },
  200178. "rgb_I.rst": {
  200179. "hide_name": 0,
  200180. "bits": [ 127 ],
  200181. "attributes": {
  200182. "hdlname": "rgb_I rst",
  200183. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:34.14-34.17"
  200184. }
  200185. },
  200186. "rgb_I.wb_ack": {
  200187. "hide_name": 0,
  200188. "bits": [ 5966 ],
  200189. "attributes": {
  200190. "hdlname": "rgb_I wb_ack",
  200191. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:30.21-30.27"
  200192. }
  200193. },
  200194. "rgb_I.wb_ack_SB_DFFSR_Q_D": {
  200195. "hide_name": 0,
  200196. "bits": [ 5977 ],
  200197. "attributes": {
  200198. }
  200199. },
  200200. "rgb_I.wb_ack_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  200201. "hide_name": 0,
  200202. "bits": [ 687, 6450, 5979, 5978 ],
  200203. "attributes": {
  200204. "force_downto": "00000000000000000000000000000001",
  200205. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200206. }
  200207. },
  200208. "rgb_I.wb_ack_SB_LUT4_I2_O": {
  200209. "hide_name": 0,
  200210. "bits": [ 64, 5974, 5975 ],
  200211. "attributes": {
  200212. "force_downto": "00000000000000000000000000000001",
  200213. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200214. }
  200215. },
  200216. "rgb_I.wb_addr": {
  200217. "hide_name": 0,
  200218. "bits": [ 706, 704, 701, 699, 697 ],
  200219. "attributes": {
  200220. "hdlname": "rgb_I wb_addr",
  200221. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:25.21-25.28"
  200222. }
  200223. },
  200224. "rgb_I.wb_cyc": {
  200225. "hide_name": 0,
  200226. "bits": [ 5966 ],
  200227. "attributes": {
  200228. "hdlname": "rgb_I wb_cyc",
  200229. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:29.21-29.27"
  200230. }
  200231. },
  200232. "rgb_I.wb_rdata": {
  200233. "hide_name": 0,
  200234. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  200235. "attributes": {
  200236. "hdlname": "rgb_I wb_rdata",
  200237. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:26.21-26.29"
  200238. }
  200239. },
  200240. "rgb_I.wb_wdata": {
  200241. "hide_name": 0,
  200242. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  200243. "attributes": {
  200244. "hdlname": "rgb_I wb_wdata",
  200245. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:27.21-27.29"
  200246. }
  200247. },
  200248. "rgb_I.wb_we": {
  200249. "hide_name": 0,
  200250. "bits": [ 469 ],
  200251. "attributes": {
  200252. "hdlname": "rgb_I wb_we",
  200253. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_rgb_wb.v:28.21-28.26"
  200254. }
  200255. },
  200256. "rst": {
  200257. "hide_name": 0,
  200258. "bits": [ 127 ],
  200259. "attributes": {
  200260. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:142.7-142.10"
  200261. }
  200262. },
  200263. "spi_cs_n": {
  200264. "hide_name": 0,
  200265. "bits": [ 7, 8 ],
  200266. "attributes": {
  200267. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:16.20-16.28"
  200268. }
  200269. },
  200270. "spi_io": {
  200271. "hide_name": 0,
  200272. "bits": [ 2, 3, 4, 5 ],
  200273. "attributes": {
  200274. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:14.20-14.26"
  200275. }
  200276. },
  200277. "spi_sck": {
  200278. "hide_name": 0,
  200279. "bits": [ 6 ],
  200280. "attributes": {
  200281. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:15.20-15.27"
  200282. }
  200283. },
  200284. "sync_4x": {
  200285. "hide_name": 0,
  200286. "bits": [ 5672 ],
  200287. "attributes": {
  200288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:141.7-141.14"
  200289. }
  200290. },
  200291. "sys_mgr_I.clk_1x": {
  200292. "hide_name": 0,
  200293. "bits": [ 42 ],
  200294. "attributes": {
  200295. "hdlname": "sys_mgr_I clk_1x",
  200296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:14.14-14.20"
  200297. }
  200298. },
  200299. "sys_mgr_I.clk_4x": {
  200300. "hide_name": 0,
  200301. "bits": [ 5666 ],
  200302. "attributes": {
  200303. "hdlname": "sys_mgr_I clk_4x",
  200304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:15.14-15.20"
  200305. }
  200306. },
  200307. "sys_mgr_I.clk_in": {
  200308. "hide_name": 0,
  200309. "bits": [ 31 ],
  200310. "attributes": {
  200311. "hdlname": "sys_mgr_I clk_in",
  200312. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:13.14-13.20"
  200313. }
  200314. },
  200315. "sys_mgr_I.crg_I.clk_1x": {
  200316. "hide_name": 0,
  200317. "bits": [ 42 ],
  200318. "attributes": {
  200319. "hdlname": "sys_mgr_I crg_I clk_1x",
  200320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:22.14-22.20"
  200321. }
  200322. },
  200323. "sys_mgr_I.crg_I.clk_2x": {
  200324. "hide_name": 0,
  200325. "bits": [ "0" ],
  200326. "attributes": {
  200327. "hdlname": "sys_mgr_I crg_I clk_2x",
  200328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:23.14-23.20"
  200329. }
  200330. },
  200331. "sys_mgr_I.crg_I.clk_4x": {
  200332. "hide_name": 0,
  200333. "bits": [ 5666 ],
  200334. "attributes": {
  200335. "hdlname": "sys_mgr_I crg_I clk_4x",
  200336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:18.14-18.20"
  200337. }
  200338. },
  200339. "sys_mgr_I.crg_I.clk_div": {
  200340. "hide_name": 0,
  200341. "bits": [ 7242, 5982 ],
  200342. "attributes": {
  200343. "hdlname": "sys_mgr_I crg_I clk_div",
  200344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:36.13-36.20",
  200345. "unused_bits": "0 "
  200346. }
  200347. },
  200348. "sys_mgr_I.crg_I.clk_div_SB_DFFR_Q_D": {
  200349. "hide_name": 0,
  200350. "bits": [ 5986, 5981 ],
  200351. "attributes": {
  200352. "force_downto": "00000000000000000000000000000001",
  200353. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:78.15-78.35|/usr/bin/../share/yosys/techmap.v:270.26-270.27"
  200354. }
  200355. },
  200356. "sys_mgr_I.crg_I.clk_div_SB_LUT4_I1_I2": {
  200357. "hide_name": 0,
  200358. "bits": [ 5982, 5984, 5985 ],
  200359. "attributes": {
  200360. "force_downto": "00000000000000000000000000000001",
  200361. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200362. }
  200363. },
  200364. "sys_mgr_I.crg_I.clk_div_SB_LUT4_I1_I2_SB_DFFR_Q_D": {
  200365. "hide_name": 0,
  200366. "bits": [ 5986, 5982 ],
  200367. "attributes": {
  200368. "force_downto": "00000000000000000000000000000001",
  200369. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:78.15-78.35|/usr/bin/../share/yosys/techmap.v:270.23-270.24"
  200370. }
  200371. },
  200372. "sys_mgr_I.crg_I.pll_lock": {
  200373. "hide_name": 0,
  200374. "bits": [ 5988 ],
  200375. "attributes": {
  200376. "hdlname": "sys_mgr_I crg_I pll_lock",
  200377. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:19.14-19.22"
  200378. }
  200379. },
  200380. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O": {
  200381. "hide_name": 0,
  200382. "bits": [ 5983 ],
  200383. "attributes": {
  200384. }
  200385. },
  200386. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_D": {
  200387. "hide_name": 0,
  200388. "bits": [ 5993, 5991, 5989, 7243 ],
  200389. "attributes": {
  200390. "unused_bits": "3"
  200391. }
  200392. },
  200393. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFR_R_Q": {
  200394. "hide_name": 0,
  200395. "bits": [ 5985, 5990, 5994, 5992 ],
  200396. "attributes": {
  200397. "force_downto": "00000000000000000000000000000001",
  200398. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200399. }
  200400. },
  200401. "sys_mgr_I.crg_I.pll_lock_SB_LUT4_I3_O_SB_DFFS_S_D": {
  200402. "hide_name": 0,
  200403. "bits": [ 5995 ],
  200404. "attributes": {
  200405. }
  200406. },
  200407. "sys_mgr_I.crg_I.rst": {
  200408. "hide_name": 0,
  200409. "bits": [ 127 ],
  200410. "attributes": {
  200411. "hdlname": "sys_mgr_I crg_I rst",
  200412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:24.14-24.17"
  200413. }
  200414. },
  200415. "sys_mgr_I.crg_I.rst_i": {
  200416. "hide_name": 0,
  200417. "bits": [ 5987 ],
  200418. "attributes": {
  200419. "hdlname": "sys_mgr_I crg_I rst_i",
  200420. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:33.13-33.18"
  200421. }
  200422. },
  200423. "sys_mgr_I.crg_I.rst_i_SB_DFFS_Q_D": {
  200424. "hide_name": 0,
  200425. "bits": [ 5996 ],
  200426. "attributes": {
  200427. }
  200428. },
  200429. "sys_mgr_I.crg_I.rst_init.i": {
  200430. "hide_name": 0,
  200431. "bits": [ "0", "0", "0", "0", "1", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  200432. "signed": 1,
  200433. "attributes": {
  200434. "hdlname": "sys_mgr_I crg_I rst_init.i",
  200435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_crg.v:45.11-45.12"
  200436. }
  200437. },
  200438. "sys_mgr_I.pll_lock": {
  200439. "hide_name": 0,
  200440. "bits": [ 5988 ],
  200441. "attributes": {
  200442. "hdlname": "sys_mgr_I pll_lock",
  200443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:20.7-20.15"
  200444. }
  200445. },
  200446. "sys_mgr_I.rst": {
  200447. "hide_name": 0,
  200448. "bits": [ 127 ],
  200449. "attributes": {
  200450. "hdlname": "sys_mgr_I rst",
  200451. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:17.14-17.17"
  200452. }
  200453. },
  200454. "sys_mgr_I.sync_4x": {
  200455. "hide_name": 0,
  200456. "bits": [ 5672 ],
  200457. "attributes": {
  200458. "hdlname": "sys_mgr_I sync_4x",
  200459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/sysmgr.v:16.14-16.21"
  200460. }
  200461. },
  200462. "sys_mgr_I.sync_96m_I.clk_fast": {
  200463. "hide_name": 0,
  200464. "bits": [ 5666 ],
  200465. "attributes": {
  200466. "hdlname": "sys_mgr_I sync_96m_I clk_fast",
  200467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:22.14-22.22"
  200468. }
  200469. },
  200470. "sys_mgr_I.sync_96m_I.clk_samp": {
  200471. "hide_name": 0,
  200472. "bits": [ 6004, 7244 ],
  200473. "attributes": {
  200474. "hdlname": "sys_mgr_I sync_96m_I clk_samp",
  200475. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:29.13-29.21",
  200476. "unused_bits": "1 "
  200477. }
  200478. },
  200479. "sys_mgr_I.sync_96m_I.clk_slow": {
  200480. "hide_name": 0,
  200481. "bits": [ 42 ],
  200482. "attributes": {
  200483. "hdlname": "sys_mgr_I sync_96m_I clk_slow",
  200484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:21.14-21.22"
  200485. }
  200486. },
  200487. "sys_mgr_I.sync_96m_I.cnt_next": {
  200488. "hide_name": 0,
  200489. "bits": [ 5999, 6001 ],
  200490. "attributes": {
  200491. "hdlname": "sys_mgr_I sync_96m_I cnt_next",
  200492. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:32.13-32.21"
  200493. }
  200494. },
  200495. "sys_mgr_I.sync_96m_I.cnt_val": {
  200496. "hide_name": 0,
  200497. "bits": [ 5997, 6000 ],
  200498. "attributes": {
  200499. "hdlname": "sys_mgr_I sync_96m_I cnt_val",
  200500. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:33.13-33.20"
  200501. }
  200502. },
  200503. "sys_mgr_I.sync_96m_I.edge_det": {
  200504. "hide_name": 0,
  200505. "bits": [ 6005, 6006 ],
  200506. "attributes": {
  200507. "hdlname": "sys_mgr_I sync_96m_I edge_det",
  200508. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:30.13-30.21"
  200509. }
  200510. },
  200511. "sys_mgr_I.sync_96m_I.edge_found": {
  200512. "hide_name": 0,
  200513. "bits": [ 7245, 5998 ],
  200514. "attributes": {
  200515. "hdlname": "sys_mgr_I sync_96m_I edge_found",
  200516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:31.13-31.23",
  200517. "unused_bits": "0 "
  200518. }
  200519. },
  200520. "sys_mgr_I.sync_96m_I.ff_cnt0_I.c": {
  200521. "hide_name": 0,
  200522. "bits": [ 5666 ],
  200523. "attributes": {
  200524. "hdlname": "sys_mgr_I sync_96m_I ff_cnt0_I c",
  200525. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200526. }
  200527. },
  200528. "sys_mgr_I.sync_96m_I.ff_cnt0_I.d": {
  200529. "hide_name": 0,
  200530. "bits": [ 5999 ],
  200531. "attributes": {
  200532. "hdlname": "sys_mgr_I sync_96m_I ff_cnt0_I d",
  200533. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200534. }
  200535. },
  200536. "sys_mgr_I.sync_96m_I.ff_cnt0_I.q": {
  200537. "hide_name": 0,
  200538. "bits": [ 5997 ],
  200539. "attributes": {
  200540. "hdlname": "sys_mgr_I sync_96m_I ff_cnt0_I q",
  200541. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  200542. }
  200543. },
  200544. "sys_mgr_I.sync_96m_I.ff_cnt0_I.r": {
  200545. "hide_name": 0,
  200546. "bits": [ 127 ],
  200547. "attributes": {
  200548. "hdlname": "sys_mgr_I sync_96m_I ff_cnt0_I r",
  200549. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200550. }
  200551. },
  200552. "sys_mgr_I.sync_96m_I.ff_cnt1_I.c": {
  200553. "hide_name": 0,
  200554. "bits": [ 5666 ],
  200555. "attributes": {
  200556. "hdlname": "sys_mgr_I sync_96m_I ff_cnt1_I c",
  200557. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200558. }
  200559. },
  200560. "sys_mgr_I.sync_96m_I.ff_cnt1_I.d": {
  200561. "hide_name": 0,
  200562. "bits": [ 6001 ],
  200563. "attributes": {
  200564. "hdlname": "sys_mgr_I sync_96m_I ff_cnt1_I d",
  200565. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200566. }
  200567. },
  200568. "sys_mgr_I.sync_96m_I.ff_cnt1_I.q": {
  200569. "hide_name": 0,
  200570. "bits": [ 6000 ],
  200571. "attributes": {
  200572. "hdlname": "sys_mgr_I sync_96m_I ff_cnt1_I q",
  200573. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  200574. }
  200575. },
  200576. "sys_mgr_I.sync_96m_I.ff_cnt1_I.r": {
  200577. "hide_name": 0,
  200578. "bits": [ 127 ],
  200579. "attributes": {
  200580. "hdlname": "sys_mgr_I sync_96m_I ff_cnt1_I r",
  200581. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200582. }
  200583. },
  200584. "sys_mgr_I.sync_96m_I.ff_edge0_I.c": {
  200585. "hide_name": 0,
  200586. "bits": [ 5666 ],
  200587. "attributes": {
  200588. "hdlname": "sys_mgr_I sync_96m_I ff_edge0_I c",
  200589. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200590. }
  200591. },
  200592. "sys_mgr_I.sync_96m_I.ff_edge0_I.d": {
  200593. "hide_name": 0,
  200594. "bits": [ 6005 ],
  200595. "attributes": {
  200596. "hdlname": "sys_mgr_I sync_96m_I ff_edge0_I d",
  200597. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200598. }
  200599. },
  200600. "sys_mgr_I.sync_96m_I.ff_edge0_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I_Q": {
  200601. "hide_name": 0,
  200602. "bits": [ 6002, 6003, 6004 ],
  200603. "attributes": {
  200604. "force_downto": "00000000000000000000000000000001",
  200605. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200606. }
  200607. },
  200608. "sys_mgr_I.sync_96m_I.ff_edge0_I.q": {
  200609. "hide_name": 0,
  200610. "bits": [ 7245 ],
  200611. "attributes": {
  200612. "hdlname": "sys_mgr_I sync_96m_I ff_edge0_I q",
  200613. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15",
  200614. "unused_bits": "0 "
  200615. }
  200616. },
  200617. "sys_mgr_I.sync_96m_I.ff_edge0_I.r": {
  200618. "hide_name": 0,
  200619. "bits": [ 127 ],
  200620. "attributes": {
  200621. "hdlname": "sys_mgr_I sync_96m_I ff_edge0_I r",
  200622. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200623. }
  200624. },
  200625. "sys_mgr_I.sync_96m_I.ff_edge1_I.c": {
  200626. "hide_name": 0,
  200627. "bits": [ 5666 ],
  200628. "attributes": {
  200629. "hdlname": "sys_mgr_I sync_96m_I ff_edge1_I c",
  200630. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200631. }
  200632. },
  200633. "sys_mgr_I.sync_96m_I.ff_edge1_I.d": {
  200634. "hide_name": 0,
  200635. "bits": [ 6006 ],
  200636. "attributes": {
  200637. "hdlname": "sys_mgr_I sync_96m_I ff_edge1_I d",
  200638. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200639. }
  200640. },
  200641. "sys_mgr_I.sync_96m_I.ff_edge1_I.q": {
  200642. "hide_name": 0,
  200643. "bits": [ 5998 ],
  200644. "attributes": {
  200645. "hdlname": "sys_mgr_I sync_96m_I ff_edge1_I q",
  200646. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  200647. }
  200648. },
  200649. "sys_mgr_I.sync_96m_I.ff_edge1_I.r": {
  200650. "hide_name": 0,
  200651. "bits": [ 127 ],
  200652. "attributes": {
  200653. "hdlname": "sys_mgr_I sync_96m_I ff_edge1_I r",
  200654. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200655. }
  200656. },
  200657. "sys_mgr_I.sync_96m_I.ff_samp0_I.c": {
  200658. "hide_name": 0,
  200659. "bits": [ 5666 ],
  200660. "attributes": {
  200661. "hdlname": "sys_mgr_I sync_96m_I ff_samp0_I c",
  200662. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200663. }
  200664. },
  200665. "sys_mgr_I.sync_96m_I.ff_samp0_I.d": {
  200666. "hide_name": 0,
  200667. "bits": [ 42 ],
  200668. "attributes": {
  200669. "hdlname": "sys_mgr_I sync_96m_I ff_samp0_I d",
  200670. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200671. }
  200672. },
  200673. "sys_mgr_I.sync_96m_I.ff_samp0_I.q": {
  200674. "hide_name": 0,
  200675. "bits": [ 6004 ],
  200676. "attributes": {
  200677. "hdlname": "sys_mgr_I sync_96m_I ff_samp0_I q",
  200678. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  200679. }
  200680. },
  200681. "sys_mgr_I.sync_96m_I.ff_samp0_I.r": {
  200682. "hide_name": 0,
  200683. "bits": [ 127 ],
  200684. "attributes": {
  200685. "hdlname": "sys_mgr_I sync_96m_I ff_samp0_I r",
  200686. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200687. }
  200688. },
  200689. "sys_mgr_I.sync_96m_I.ff_samp1_I.c": {
  200690. "hide_name": 0,
  200691. "bits": [ 5666 ],
  200692. "attributes": {
  200693. "hdlname": "sys_mgr_I sync_96m_I ff_samp1_I c",
  200694. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200695. }
  200696. },
  200697. "sys_mgr_I.sync_96m_I.ff_samp1_I.d": {
  200698. "hide_name": 0,
  200699. "bits": [ 6004 ],
  200700. "attributes": {
  200701. "hdlname": "sys_mgr_I sync_96m_I ff_samp1_I d",
  200702. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200703. }
  200704. },
  200705. "sys_mgr_I.sync_96m_I.ff_samp1_I.q": {
  200706. "hide_name": 0,
  200707. "bits": [ 7244 ],
  200708. "attributes": {
  200709. "hdlname": "sys_mgr_I sync_96m_I ff_samp1_I q",
  200710. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15",
  200711. "unused_bits": "0 "
  200712. }
  200713. },
  200714. "sys_mgr_I.sync_96m_I.ff_samp1_I.r": {
  200715. "hide_name": 0,
  200716. "bits": [ 127 ],
  200717. "attributes": {
  200718. "hdlname": "sys_mgr_I sync_96m_I ff_samp1_I r",
  200719. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200720. }
  200721. },
  200722. "sys_mgr_I.sync_96m_I.ff_sync0_I.c": {
  200723. "hide_name": 0,
  200724. "bits": [ 5666 ],
  200725. "attributes": {
  200726. "hdlname": "sys_mgr_I sync_96m_I ff_sync0_I c",
  200727. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200728. }
  200729. },
  200730. "sys_mgr_I.sync_96m_I.ff_sync0_I.d": {
  200731. "hide_name": 0,
  200732. "bits": [ 6007 ],
  200733. "attributes": {
  200734. "hdlname": "sys_mgr_I sync_96m_I ff_sync0_I d",
  200735. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200736. }
  200737. },
  200738. "sys_mgr_I.sync_96m_I.ff_sync0_I.q": {
  200739. "hide_name": 0,
  200740. "bits": [ 5672 ],
  200741. "attributes": {
  200742. "hdlname": "sys_mgr_I sync_96m_I ff_sync0_I q",
  200743. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:21.14-21.15"
  200744. }
  200745. },
  200746. "sys_mgr_I.sync_96m_I.ff_sync0_I.r": {
  200747. "hide_name": 0,
  200748. "bits": [ 127 ],
  200749. "attributes": {
  200750. "hdlname": "sys_mgr_I sync_96m_I ff_sync0_I r",
  200751. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200752. }
  200753. },
  200754. "sys_mgr_I.sync_96m_I.ff_sync1_I.c": {
  200755. "hide_name": 0,
  200756. "bits": [ 5666 ],
  200757. "attributes": {
  200758. "hdlname": "sys_mgr_I sync_96m_I ff_sync1_I c",
  200759. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:24.14-24.15"
  200760. }
  200761. },
  200762. "sys_mgr_I.sync_96m_I.ff_sync1_I.d": {
  200763. "hide_name": 0,
  200764. "bits": [ 6008 ],
  200765. "attributes": {
  200766. "hdlname": "sys_mgr_I sync_96m_I ff_sync1_I d",
  200767. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:20.14-20.15"
  200768. }
  200769. },
  200770. "sys_mgr_I.sync_96m_I.ff_sync1_I.genblk1.genblk1.genblk1.genblk1.genblk1.dff_I_Q": {
  200771. "hide_name": 0,
  200772. "bits": [ 6009 ],
  200773. "attributes": {
  200774. "unused_bits": "0 "
  200775. }
  200776. },
  200777. "sys_mgr_I.sync_96m_I.ff_sync1_I.r": {
  200778. "hide_name": 0,
  200779. "bits": [ 127 ],
  200780. "attributes": {
  200781. "hdlname": "sys_mgr_I sync_96m_I ff_sync1_I r",
  200782. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_dff.v:23.14-23.15"
  200783. }
  200784. },
  200785. "sys_mgr_I.sync_96m_I.rst": {
  200786. "hide_name": 0,
  200787. "bits": [ 127 ],
  200788. "attributes": {
  200789. "hdlname": "sys_mgr_I sync_96m_I rst",
  200790. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:23.14-23.17"
  200791. }
  200792. },
  200793. "sys_mgr_I.sync_96m_I.sync": {
  200794. "hide_name": 0,
  200795. "bits": [ 5672 ],
  200796. "attributes": {
  200797. "hdlname": "sys_mgr_I sync_96m_I sync",
  200798. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:24.14-24.18"
  200799. }
  200800. },
  200801. "sys_mgr_I.sync_96m_I.sync_i": {
  200802. "hide_name": 0,
  200803. "bits": [ 5672, 7246 ],
  200804. "attributes": {
  200805. "hdlname": "sys_mgr_I sync_96m_I sync_i",
  200806. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:36.13-36.19",
  200807. "unused_bits": "1 "
  200808. }
  200809. },
  200810. "sys_mgr_I.sync_96m_I.sync_next": {
  200811. "hide_name": 0,
  200812. "bits": [ 6007, 6008 ],
  200813. "attributes": {
  200814. "hdlname": "sys_mgr_I sync_96m_I sync_next",
  200815. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2ice40//rtl/ice40_serdes_sync.v:35.13-35.22"
  200816. }
  200817. },
  200818. "uart_I.clk": {
  200819. "hide_name": 0,
  200820. "bits": [ 42 ],
  200821. "attributes": {
  200822. "hdlname": "uart_I clk",
  200823. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:29.14-29.17"
  200824. }
  200825. },
  200826. "uart_I.rst": {
  200827. "hide_name": 0,
  200828. "bits": [ 127 ],
  200829. "attributes": {
  200830. "hdlname": "uart_I rst",
  200831. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:30.14-30.17"
  200832. }
  200833. },
  200834. "uart_I.uart_div": {
  200835. "hide_name": 0,
  200836. "bits": [ 6014, 6013, 6022, 6021, 6020, 6019, 6018, 6017, 6016, 6015, 6012, 6011 ],
  200837. "attributes": {
  200838. "hdlname": "uart_I uart_div",
  200839. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:65.23-65.31"
  200840. }
  200841. },
  200842. "uart_I.uart_rx": {
  200843. "hide_name": 0,
  200844. "bits": [ 25 ],
  200845. "attributes": {
  200846. "hdlname": "uart_I uart_rx",
  200847. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:18.14-18.21"
  200848. }
  200849. },
  200850. "uart_I.uart_rx_I.bit_cnt": {
  200851. "hide_name": 0,
  200852. "bits": [ 6032, 6030, 6028, 6034, 6025 ],
  200853. "attributes": {
  200854. "hdlname": "uart_I uart_rx_I bit_cnt",
  200855. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:30.12-30.19"
  200856. }
  200857. },
  200858. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D": {
  200859. "hide_name": 0,
  200860. "bits": [ 6031, 6029, 6027, 6033, 6023 ],
  200861. "attributes": {
  200862. "force_downto": "00000000000000000000000000000001",
  200863. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  200864. }
  200865. },
  200866. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_1_I3": {
  200867. "hide_name": 0,
  200868. "bits": [ "0", 6025, "1", 6036 ],
  200869. "attributes": {
  200870. "force_downto": "00000000000000000000000000000001",
  200871. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200872. }
  200873. },
  200874. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_3_I3": {
  200875. "hide_name": 0,
  200876. "bits": [ "0", 6028, "1", 6037 ],
  200877. "attributes": {
  200878. "force_downto": "00000000000000000000000000000001",
  200879. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200880. }
  200881. },
  200882. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_I3": {
  200883. "hide_name": 0,
  200884. "bits": [ "0", 6034, "1", 6035 ],
  200885. "attributes": {
  200886. "force_downto": "00000000000000000000000000000001",
  200887. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:92.15-92.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  200888. }
  200889. },
  200890. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_E": {
  200891. "hide_name": 0,
  200892. "bits": [ 6024 ],
  200893. "attributes": {
  200894. }
  200895. },
  200896. "uart_I.uart_rx_I.bit_cnt_SB_DFFESS_Q_S": {
  200897. "hide_name": 0,
  200898. "bits": [ 6026 ],
  200899. "attributes": {
  200900. }
  200901. },
  200902. "uart_I.uart_rx_I.ce": {
  200903. "hide_name": 0,
  200904. "bits": [ 6038 ],
  200905. "attributes": {
  200906. "hdlname": "uart_I uart_rx_I ce",
  200907. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:27.17-27.19"
  200908. }
  200909. },
  200910. "uart_I.uart_rx_I.clk": {
  200911. "hide_name": 0,
  200912. "bits": [ 42 ],
  200913. "attributes": {
  200914. "hdlname": "uart_I uart_rx_I clk",
  200915. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:20.14-20.17"
  200916. }
  200917. },
  200918. "uart_I.uart_rx_I.data": {
  200919. "hide_name": 0,
  200920. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131 ],
  200921. "attributes": {
  200922. "hdlname": "uart_I uart_rx_I data",
  200923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:17.20-17.24"
  200924. }
  200925. },
  200926. "uart_I.uart_rx_I.div": {
  200927. "hide_name": 0,
  200928. "bits": [ 6014, 6013, 6022, 6021, 6020, 6019, 6018, 6017, 6016, 6015, 6012, 6011 ],
  200929. "attributes": {
  200930. "hdlname": "uart_I uart_rx_I div",
  200931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:19.30-19.33"
  200932. }
  200933. },
  200934. "uart_I.uart_rx_I.div_cnt": {
  200935. "hide_name": 0,
  200936. "bits": [ 6048, 6046, 6064, 6062, 6060, 6058, 6056, 6054, 6052, 6050, 6044, 6042, 6038 ],
  200937. "attributes": {
  200938. "hdlname": "uart_I uart_rx_I div_cnt",
  200939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:29.20-29.27"
  200940. }
  200941. },
  200942. "uart_I.uart_rx_I.genblk1.gf_I.all_one": {
  200943. "hide_name": 0,
  200944. "bits": [ "1", "1" ],
  200945. "attributes": {
  200946. "hdlname": "uart_I uart_rx_I genblk1.gf_I all_one",
  200947. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:32.15-32.22"
  200948. }
  200949. },
  200950. "uart_I.uart_rx_I.genblk1.gf_I.all_rst": {
  200951. "hide_name": 0,
  200952. "bits": [ "1", "1" ],
  200953. "attributes": {
  200954. "hdlname": "uart_I uart_rx_I genblk1.gf_I all_rst",
  200955. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:33.15-33.22"
  200956. }
  200957. },
  200958. "uart_I.uart_rx_I.genblk1.gf_I.all_zero": {
  200959. "hide_name": 0,
  200960. "bits": [ "0", "0" ],
  200961. "attributes": {
  200962. "hdlname": "uart_I uart_rx_I genblk1.gf_I all_zero",
  200963. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:31.15-31.23"
  200964. }
  200965. },
  200966. "uart_I.uart_rx_I.genblk1.gf_I.clk": {
  200967. "hide_name": 0,
  200968. "bits": [ 42 ],
  200969. "attributes": {
  200970. "hdlname": "uart_I uart_rx_I genblk1.gf_I clk",
  200971. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:27.14-27.17"
  200972. }
  200973. },
  200974. "uart_I.uart_rx_I.genblk1.gf_I.cnt": {
  200975. "hide_name": 0,
  200976. "bits": [ 6068, 6066 ],
  200977. "attributes": {
  200978. "hdlname": "uart_I uart_rx_I genblk1.gf_I cnt",
  200979. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:40.15-40.18"
  200980. }
  200981. },
  200982. "uart_I.uart_rx_I.genblk1.gf_I.cnt_SB_DFFSS_Q_1_D": {
  200983. "hide_name": 0,
  200984. "bits": [ 6067, 7247 ],
  200985. "attributes": {
  200986. "force_downto": "00000000000000000000000000000001",
  200987. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:74.11-74.25|/usr/bin/../share/yosys/techmap.v:270.23-270.24",
  200988. "unused_bits": "1 "
  200989. }
  200990. },
  200991. "uart_I.uart_rx_I.genblk1.gf_I.cnt_SB_DFFSS_Q_D": {
  200992. "hide_name": 0,
  200993. "bits": [ 6067, 6065 ],
  200994. "attributes": {
  200995. "force_downto": "00000000000000000000000000000001",
  200996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:74.11-74.25|/usr/bin/../share/yosys/techmap.v:270.26-270.27"
  200997. }
  200998. },
  200999. "uart_I.uart_rx_I.genblk1.gf_I.evt_cond_i": {
  201000. "hide_name": 0,
  201001. "bits": [ "1" ],
  201002. "attributes": {
  201003. "hdlname": "uart_I uart_rx_I genblk1.gf_I evt_cond_i",
  201004. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:36.7-36.17"
  201005. }
  201006. },
  201007. "uart_I.uart_rx_I.genblk1.gf_I.fall": {
  201008. "hide_name": 0,
  201009. "bits": [ 6071 ],
  201010. "attributes": {
  201011. "hdlname": "uart_I uart_rx_I genblk1.gf_I fall",
  201012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:25.14-25.18"
  201013. }
  201014. },
  201015. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_DFF_Q_D": {
  201016. "hide_name": 0,
  201017. "bits": [ 6070 ],
  201018. "attributes": {
  201019. }
  201020. },
  201021. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O": {
  201022. "hide_name": 0,
  201023. "bits": [ 6073 ],
  201024. "attributes": {
  201025. }
  201026. },
  201027. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q": {
  201028. "hide_name": 0,
  201029. "bits": [ 6038, 6011, 6039, 6075 ],
  201030. "attributes": {
  201031. "force_downto": "00000000000000000000000000000001",
  201032. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201033. }
  201034. },
  201035. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3": {
  201036. "hide_name": 0,
  201037. "bits": [ "0", 6042, "1", 6074 ],
  201038. "attributes": {
  201039. "force_downto": "00000000000000000000000000000001",
  201040. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201041. }
  201042. },
  201043. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO": {
  201044. "hide_name": 0,
  201045. "bits": [ 6039, 6038, 6077, 6076 ],
  201046. "attributes": {
  201047. "force_downto": "00000000000000000000000000000001",
  201048. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201049. }
  201050. },
  201051. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_I2": {
  201052. "hide_name": 0,
  201053. "bits": [ 6077 ],
  201054. "attributes": {
  201055. "abc9_carry": "00000000000000000000000000000001",
  201056. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201057. }
  201058. },
  201059. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_I2_SB_CARRY_CO_CI": {
  201060. "hide_name": 0,
  201061. "bits": [ 6078 ],
  201062. "attributes": {
  201063. "abc9_carry": "00000000000000000000000000000001",
  201064. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201065. }
  201066. },
  201067. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  201068. "hide_name": 0,
  201069. "bits": [ 6047, 6045, 6063, 6061, 6059, 6057, 6055, 6053, 6051, 6049, 6043, 6041, 6040 ],
  201070. "attributes": {
  201071. }
  201072. },
  201073. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_10_I1": {
  201074. "hide_name": 0,
  201075. "bits": [ 6082, 6039, 6083 ],
  201076. "attributes": {
  201077. "force_downto": "00000000000000000000000000000001",
  201078. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201079. }
  201080. },
  201081. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_10_I1_SB_LUT4_O_1_I3": {
  201082. "hide_name": 0,
  201083. "bits": [ 6038, 6013, 6084 ],
  201084. "attributes": {
  201085. "force_downto": "00000000000000000000000000000001",
  201086. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201087. }
  201088. },
  201089. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_11_I2": {
  201090. "hide_name": 0,
  201091. "bits": [ 6039, 6085, 6086 ],
  201092. "attributes": {
  201093. "force_downto": "00000000000000000000000000000001",
  201094. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201095. }
  201096. },
  201097. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_1_I3": {
  201098. "hide_name": 0,
  201099. "bits": [ 6013, 6039, 6081 ],
  201100. "attributes": {
  201101. "force_downto": "00000000000000000000000000000001",
  201102. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201103. }
  201104. },
  201105. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_2_I2": {
  201106. "hide_name": 0,
  201107. "bits": [ 6039, 6087, 6088 ],
  201108. "attributes": {
  201109. "force_downto": "00000000000000000000000000000001",
  201110. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201111. }
  201112. },
  201113. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_2_I2_SB_LUT4_O_I3": {
  201114. "hide_name": 0,
  201115. "bits": [ 6079 ],
  201116. "attributes": {
  201117. "abc9_carry": "00000000000000000000000000000001",
  201118. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201119. }
  201120. },
  201121. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3_I2": {
  201122. "hide_name": 0,
  201123. "bits": [ 6039, 6091, 6092 ],
  201124. "attributes": {
  201125. "force_downto": "00000000000000000000000000000001",
  201126. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201127. }
  201128. },
  201129. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3_I2_SB_LUT4_O_1_I3": {
  201130. "hide_name": 0,
  201131. "bits": [ 6038, 6016, 6093 ],
  201132. "attributes": {
  201133. "force_downto": "00000000000000000000000000000001",
  201134. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201135. }
  201136. },
  201137. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_3_I2_SB_LUT4_O_I3": {
  201138. "hide_name": 0,
  201139. "bits": [ 6090 ],
  201140. "attributes": {
  201141. "abc9_carry": "00000000000000000000000000000001",
  201142. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201143. }
  201144. },
  201145. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2": {
  201146. "hide_name": 0,
  201147. "bits": [ 6039, 6095, 6096 ],
  201148. "attributes": {
  201149. "force_downto": "00000000000000000000000000000001",
  201150. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201151. }
  201152. },
  201153. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2_SB_LUT4_O_1_I3": {
  201154. "hide_name": 0,
  201155. "bits": [ 6038, 6017, 6097 ],
  201156. "attributes": {
  201157. "force_downto": "00000000000000000000000000000001",
  201158. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201159. }
  201160. },
  201161. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_4_I2_SB_LUT4_O_I3": {
  201162. "hide_name": 0,
  201163. "bits": [ 6094 ],
  201164. "attributes": {
  201165. "abc9_carry": "00000000000000000000000000000001",
  201166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201167. }
  201168. },
  201169. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2": {
  201170. "hide_name": 0,
  201171. "bits": [ 6039, 6100, 6101 ],
  201172. "attributes": {
  201173. "force_downto": "00000000000000000000000000000001",
  201174. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201175. }
  201176. },
  201177. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_1_I3": {
  201178. "hide_name": 0,
  201179. "bits": [ 6038, 6018, 6102 ],
  201180. "attributes": {
  201181. "force_downto": "00000000000000000000000000000001",
  201182. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201183. }
  201184. },
  201185. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  201186. "hide_name": 0,
  201187. "bits": [ "0", 6056, "1", 6103 ],
  201188. "attributes": {
  201189. "force_downto": "00000000000000000000000000000001",
  201190. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201191. }
  201192. },
  201193. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_5_I2_SB_LUT4_O_I3": {
  201194. "hide_name": 0,
  201195. "bits": [ 6099 ],
  201196. "attributes": {
  201197. "abc9_carry": "00000000000000000000000000000001",
  201198. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201199. }
  201200. },
  201201. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2": {
  201202. "hide_name": 0,
  201203. "bits": [ 6039, 6106, 6107 ],
  201204. "attributes": {
  201205. "force_downto": "00000000000000000000000000000001",
  201206. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201207. }
  201208. },
  201209. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_1_I3": {
  201210. "hide_name": 0,
  201211. "bits": [ 6038, 6019, 6108 ],
  201212. "attributes": {
  201213. "force_downto": "00000000000000000000000000000001",
  201214. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201215. }
  201216. },
  201217. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  201218. "hide_name": 0,
  201219. "bits": [ "0", 6058, "1", 6104 ],
  201220. "attributes": {
  201221. "force_downto": "00000000000000000000000000000001",
  201222. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201223. }
  201224. },
  201225. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_6_I2_SB_LUT4_O_I3": {
  201226. "hide_name": 0,
  201227. "bits": [ 6105 ],
  201228. "attributes": {
  201229. "abc9_carry": "00000000000000000000000000000001",
  201230. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201231. }
  201232. },
  201233. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2": {
  201234. "hide_name": 0,
  201235. "bits": [ 6039, 6111, 6112 ],
  201236. "attributes": {
  201237. "force_downto": "00000000000000000000000000000001",
  201238. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201239. }
  201240. },
  201241. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_1_I3": {
  201242. "hide_name": 0,
  201243. "bits": [ 6038, 6020, 6113 ],
  201244. "attributes": {
  201245. "force_downto": "00000000000000000000000000000001",
  201246. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201247. }
  201248. },
  201249. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  201250. "hide_name": 0,
  201251. "bits": [ "0", 6060, "1", 6109 ],
  201252. "attributes": {
  201253. "force_downto": "00000000000000000000000000000001",
  201254. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201255. }
  201256. },
  201257. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_7_I2_SB_LUT4_O_I3": {
  201258. "hide_name": 0,
  201259. "bits": [ 6110 ],
  201260. "attributes": {
  201261. "abc9_carry": "00000000000000000000000000000001",
  201262. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201263. }
  201264. },
  201265. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2": {
  201266. "hide_name": 0,
  201267. "bits": [ 6039, 6116, 6117 ],
  201268. "attributes": {
  201269. "force_downto": "00000000000000000000000000000001",
  201270. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201271. }
  201272. },
  201273. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_1_I3": {
  201274. "hide_name": 0,
  201275. "bits": [ 6038, 6021, 6118 ],
  201276. "attributes": {
  201277. "force_downto": "00000000000000000000000000000001",
  201278. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201279. }
  201280. },
  201281. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  201282. "hide_name": 0,
  201283. "bits": [ "0", 6062, "1", 6114 ],
  201284. "attributes": {
  201285. "force_downto": "00000000000000000000000000000001",
  201286. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201287. }
  201288. },
  201289. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_I3": {
  201290. "hide_name": 0,
  201291. "bits": [ 6115 ],
  201292. "attributes": {
  201293. "abc9_carry": "00000000000000000000000000000001",
  201294. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201295. }
  201296. },
  201297. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1": {
  201298. "hide_name": 0,
  201299. "bits": [ 6121, 6039, 6122 ],
  201300. "attributes": {
  201301. "force_downto": "00000000000000000000000000000001",
  201302. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201303. }
  201304. },
  201305. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_1_I3": {
  201306. "hide_name": 0,
  201307. "bits": [ 6038, 6022, 6123 ],
  201308. "attributes": {
  201309. "force_downto": "00000000000000000000000000000001",
  201310. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201311. }
  201312. },
  201313. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_1_I3_SB_LUT4_O_I3": {
  201314. "hide_name": 0,
  201315. "bits": [ "0", 6064, "1", 6119 ],
  201316. "attributes": {
  201317. "force_downto": "00000000000000000000000000000001",
  201318. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201319. }
  201320. },
  201321. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_9_I1_SB_LUT4_O_I3": {
  201322. "hide_name": 0,
  201323. "bits": [ 6120 ],
  201324. "attributes": {
  201325. "abc9_carry": "00000000000000000000000000000001",
  201326. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:79.15-79.48|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201327. }
  201328. },
  201329. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_O_I3": {
  201330. "hide_name": 0,
  201331. "bits": [ 6039, 6077, 6080 ],
  201332. "attributes": {
  201333. "force_downto": "00000000000000000000000000000001",
  201334. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201335. }
  201336. },
  201337. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  201338. "hide_name": 0,
  201339. "bits": [ "0", 6044, "1", 6124 ],
  201340. "attributes": {
  201341. "force_downto": "00000000000000000000000000000001",
  201342. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201343. }
  201344. },
  201345. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  201346. "hide_name": 0,
  201347. "bits": [ "0", 6050, "1", 6125 ],
  201348. "attributes": {
  201349. "force_downto": "00000000000000000000000000000001",
  201350. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201351. }
  201352. },
  201353. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  201354. "hide_name": 0,
  201355. "bits": [ "0", 6052, "1", 6126 ],
  201356. "attributes": {
  201357. "force_downto": "00000000000000000000000000000001",
  201358. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201359. }
  201360. },
  201361. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  201362. "hide_name": 0,
  201363. "bits": [ "0", 6054, "1", 6098 ],
  201364. "attributes": {
  201365. "force_downto": "00000000000000000000000000000001",
  201366. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:83.15-83.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201367. }
  201368. },
  201369. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_LUT4_I3_O": {
  201370. "hide_name": 0,
  201371. "bits": [ 6038, 6015, 6089 ],
  201372. "attributes": {
  201373. "force_downto": "00000000000000000000000000000001",
  201374. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201375. }
  201376. },
  201377. "uart_I.uart_rx_I.genblk1.gf_I.fall_SB_LUT4_I1_O_SB_DFFR_D_Q_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O": {
  201378. "hide_name": 0,
  201379. "bits": [ 6038, 6012, 6127 ],
  201380. "attributes": {
  201381. "force_downto": "00000000000000000000000000000001",
  201382. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201383. }
  201384. },
  201385. "uart_I.uart_rx_I.genblk1.gf_I.in": {
  201386. "hide_name": 0,
  201387. "bits": [ 25 ],
  201388. "attributes": {
  201389. "hdlname": "uart_I uart_rx_I genblk1.gf_I in",
  201390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:19.14-19.16"
  201391. }
  201392. },
  201393. "uart_I.uart_rx_I.genblk1.gf_I.rst": {
  201394. "hide_name": 0,
  201395. "bits": [ 127 ],
  201396. "attributes": {
  201397. "hdlname": "uart_I uart_rx_I genblk1.gf_I rst",
  201398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:28.14-28.17"
  201399. }
  201400. },
  201401. "uart_I.uart_rx_I.genblk1.gf_I.samp_cond_i": {
  201402. "hide_name": 0,
  201403. "bits": [ "1" ],
  201404. "attributes": {
  201405. "hdlname": "uart_I uart_rx_I genblk1.gf_I samp_cond_i",
  201406. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:35.7-35.18"
  201407. }
  201408. },
  201409. "uart_I.uart_rx_I.genblk1.gf_I.state": {
  201410. "hide_name": 0,
  201411. "bits": [ 6072 ],
  201412. "attributes": {
  201413. "hdlname": "uart_I uart_rx_I genblk1.gf_I state",
  201414. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:39.15-39.20"
  201415. }
  201416. },
  201417. "uart_I.uart_rx_I.genblk1.gf_I.state_SB_DFFSS_Q_D": {
  201418. "hide_name": 0,
  201419. "bits": [ 6128 ],
  201420. "attributes": {
  201421. }
  201422. },
  201423. "uart_I.uart_rx_I.genblk1.gf_I.sync": {
  201424. "hide_name": 0,
  201425. "bits": [ 6129, 6069 ],
  201426. "attributes": {
  201427. "hdlname": "uart_I uart_rx_I genblk1.gf_I sync",
  201428. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:38.15-38.19"
  201429. }
  201430. },
  201431. "uart_I.uart_rx_I.genblk1.gf_I.val": {
  201432. "hide_name": 0,
  201433. "bits": [ 6072 ],
  201434. "attributes": {
  201435. "hdlname": "uart_I uart_rx_I genblk1.gf_I val",
  201436. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/glitch_filter.v:23.14-23.17"
  201437. }
  201438. },
  201439. "uart_I.uart_rx_I.rst": {
  201440. "hide_name": 0,
  201441. "bits": [ 127 ],
  201442. "attributes": {
  201443. "hdlname": "uart_I uart_rx_I rst",
  201444. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:21.14-21.17"
  201445. }
  201446. },
  201447. "uart_I.uart_rx_I.rx": {
  201448. "hide_name": 0,
  201449. "bits": [ 25 ],
  201450. "attributes": {
  201451. "hdlname": "uart_I uart_rx_I rx",
  201452. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:16.14-16.16"
  201453. }
  201454. },
  201455. "uart_I.uart_rx_I.rx_fall": {
  201456. "hide_name": 0,
  201457. "bits": [ 6071 ],
  201458. "attributes": {
  201459. "hdlname": "uart_I uart_rx_I rx_fall",
  201460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:25.7-25.14"
  201461. }
  201462. },
  201463. "uart_I.uart_rx_I.rx_val": {
  201464. "hide_name": 0,
  201465. "bits": [ 6072 ],
  201466. "attributes": {
  201467. "hdlname": "uart_I uart_rx_I rx_val",
  201468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:24.7-24.13"
  201469. }
  201470. },
  201471. "uart_I.uart_rx_I.shift": {
  201472. "hide_name": 0,
  201473. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131, 6130 ],
  201474. "attributes": {
  201475. "hdlname": "uart_I uart_rx_I shift",
  201476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:31.12-31.17"
  201477. }
  201478. },
  201479. "uart_I.uart_rx_I.stb": {
  201480. "hide_name": 0,
  201481. "bits": [ 6140 ],
  201482. "attributes": {
  201483. "hdlname": "uart_I uart_rx_I stb",
  201484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_rx.v:18.14-18.17"
  201485. }
  201486. },
  201487. "uart_I.uart_rx_I.stb_SB_DFF_Q_D": {
  201488. "hide_name": 0,
  201489. "bits": [ 6139 ],
  201490. "attributes": {
  201491. }
  201492. },
  201493. "uart_I.uart_rx_I.stb_SB_LUT4_I0_I2": {
  201494. "hide_name": 0,
  201495. "bits": [ "0", 6142, 6176, "0" ],
  201496. "attributes": {
  201497. "force_downto": "00000000000000000000000000000001",
  201498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201499. }
  201500. },
  201501. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O": {
  201502. "hide_name": 0,
  201503. "bits": [ 6144, 6154, 6150 ],
  201504. "attributes": {
  201505. "force_downto": "00000000000000000000000000000001",
  201506. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201507. }
  201508. },
  201509. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I1": {
  201510. "hide_name": 0,
  201511. "bits": [ "0", 6151, 6157, 6156 ],
  201512. "attributes": {
  201513. "force_downto": "00000000000000000000000000000001",
  201514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201515. }
  201516. },
  201517. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I2": {
  201518. "hide_name": 0,
  201519. "bits": [ "0", 6152, 6157, 6155 ],
  201520. "attributes": {
  201521. "force_downto": "00000000000000000000000000000001",
  201522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201523. }
  201524. },
  201525. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_1_I3": {
  201526. "hide_name": 0,
  201527. "bits": [ "0", 6153, 6157, 6159 ],
  201528. "attributes": {
  201529. "force_downto": "00000000000000000000000000000001",
  201530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201531. }
  201532. },
  201533. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I0": {
  201534. "hide_name": 0,
  201535. "bits": [ "0", 6146, 6157, 6161 ],
  201536. "attributes": {
  201537. "force_downto": "00000000000000000000000000000001",
  201538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201539. }
  201540. },
  201541. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I1": {
  201542. "hide_name": 0,
  201543. "bits": [ "0", 6147, 6157, 6163 ],
  201544. "attributes": {
  201545. "force_downto": "00000000000000000000000000000001",
  201546. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201547. }
  201548. },
  201549. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I2": {
  201550. "hide_name": 0,
  201551. "bits": [ "0", 6148, 6157, 6165 ],
  201552. "attributes": {
  201553. "force_downto": "00000000000000000000000000000001",
  201554. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201555. }
  201556. },
  201557. "uart_I.uart_rx_I.stb_SB_LUT4_I0_O_SB_LUT4_O_I3": {
  201558. "hide_name": 0,
  201559. "bits": [ "0", 6149, 6157, 6167 ],
  201560. "attributes": {
  201561. "force_downto": "00000000000000000000000000000001",
  201562. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201563. }
  201564. },
  201565. "uart_I.uart_rx_data": {
  201566. "hide_name": 0,
  201567. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131 ],
  201568. "attributes": {
  201569. "hdlname": "uart_I uart_rx_data",
  201570. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:61.14-61.26"
  201571. }
  201572. },
  201573. "uart_I.uart_rx_fifo_I.clk": {
  201574. "hide_name": 0,
  201575. "bits": [ 42 ],
  201576. "attributes": {
  201577. "hdlname": "uart_I uart_rx_fifo_I clk",
  201578. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:30.14-30.17"
  201579. }
  201580. },
  201581. "uart_I.uart_rx_fifo_I.lvl_dec": {
  201582. "hide_name": 0,
  201583. "bits": [ 6157 ],
  201584. "attributes": {
  201585. "hdlname": "uart_I uart_rx_fifo_I lvl_dec",
  201586. "keep": "true",
  201587. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:51.25-51.32"
  201588. }
  201589. },
  201590. "uart_I.uart_rx_fifo_I.lvl_mov": {
  201591. "hide_name": 0,
  201592. "bits": [ 6176 ],
  201593. "attributes": {
  201594. "hdlname": "uart_I uart_rx_fifo_I lvl_mov",
  201595. "keep": "true",
  201596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:52.25-52.32"
  201597. }
  201598. },
  201599. "uart_I.uart_rx_fifo_I.lvl_mov_SB_CARRY_I1_CO": {
  201600. "hide_name": 0,
  201601. "bits": [ "0", 6141, 6157, 6175 ],
  201602. "attributes": {
  201603. "force_downto": "00000000000000000000000000000001",
  201604. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201605. }
  201606. },
  201607. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O": {
  201608. "hide_name": 0,
  201609. "bits": [ 6145, 6177, 6169, 6168, 6166, 6164, 6162, 6160, 6158, 6179 ],
  201610. "attributes": {
  201611. "force_downto": "00000000000000000000000000000001",
  201612. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  201613. }
  201614. },
  201615. "uart_I.uart_rx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  201616. "hide_name": 0,
  201617. "bits": [ "0", 6143, 6157, 6178 ],
  201618. "attributes": {
  201619. "force_downto": "00000000000000000000000000000001",
  201620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201621. }
  201622. },
  201623. "uart_I.uart_rx_fifo_I.ram_I.clk": {
  201624. "hide_name": 0,
  201625. "bits": [ 42 ],
  201626. "attributes": {
  201627. "hdlname": "uart_I uart_rx_fifo_I ram_I clk",
  201628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:26.14-26.17"
  201629. }
  201630. },
  201631. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR": {
  201632. "hide_name": 0,
  201633. "bits": [ "0", "0", 6187, 6215 ],
  201634. "attributes": {
  201635. "force_downto": "00000000000000000000000000000001",
  201636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201637. }
  201638. },
  201639. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_1": {
  201640. "hide_name": 0,
  201641. "bits": [ "0", "0", 6186, 6214 ],
  201642. "attributes": {
  201643. "force_downto": "00000000000000000000000000000001",
  201644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201645. }
  201646. },
  201647. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_2": {
  201648. "hide_name": 0,
  201649. "bits": [ "0", "0", 6185, 6217 ],
  201650. "attributes": {
  201651. "force_downto": "00000000000000000000000000000001",
  201652. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201653. }
  201654. },
  201655. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_3": {
  201656. "hide_name": 0,
  201657. "bits": [ "0", "0", 6184, 6219 ],
  201658. "attributes": {
  201659. "force_downto": "00000000000000000000000000000001",
  201660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201661. }
  201662. },
  201663. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_4": {
  201664. "hide_name": 0,
  201665. "bits": [ "0", "0", 6183, 6221 ],
  201666. "attributes": {
  201667. "force_downto": "00000000000000000000000000000001",
  201668. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201669. }
  201670. },
  201671. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_5": {
  201672. "hide_name": 0,
  201673. "bits": [ "0", "0", 6182, 6223 ],
  201674. "attributes": {
  201675. "force_downto": "00000000000000000000000000000001",
  201676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201677. }
  201678. },
  201679. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_6": {
  201680. "hide_name": 0,
  201681. "bits": [ "0", "0", 6181, 6225 ],
  201682. "attributes": {
  201683. "force_downto": "00000000000000000000000000000001",
  201684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201685. }
  201686. },
  201687. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_7": {
  201688. "hide_name": 0,
  201689. "bits": [ "0", "0", 6180, 6188 ],
  201690. "attributes": {
  201691. "force_downto": "00000000000000000000000000000001",
  201692. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201693. }
  201694. },
  201695. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_8": {
  201696. "hide_name": 0,
  201697. "bits": [ 6188 ],
  201698. "attributes": {
  201699. "abc9_carry": "00000000000000000000000000000001",
  201700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  201701. }
  201702. },
  201703. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_I3": {
  201704. "hide_name": 0,
  201705. "bits": [ 6215 ],
  201706. "attributes": {
  201707. "abc9_carry": "00000000000000000000000000000001",
  201708. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201709. }
  201710. },
  201711. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O": {
  201712. "hide_name": 0,
  201713. "bits": [ 6228, 6227, 6226, 6224, 6222, 6220, 6218, 6216, 6229 ],
  201714. "attributes": {
  201715. "force_downto": "00000000000000000000000000000001",
  201716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  201717. }
  201718. },
  201719. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_1_I3": {
  201720. "hide_name": 0,
  201721. "bits": [ 6225 ],
  201722. "attributes": {
  201723. "abc9_carry": "00000000000000000000000000000001",
  201724. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201725. }
  201726. },
  201727. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  201728. "hide_name": 0,
  201729. "bits": [ 6223 ],
  201730. "attributes": {
  201731. "abc9_carry": "00000000000000000000000000000001",
  201732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201733. }
  201734. },
  201735. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  201736. "hide_name": 0,
  201737. "bits": [ 6221 ],
  201738. "attributes": {
  201739. "abc9_carry": "00000000000000000000000000000001",
  201740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201741. }
  201742. },
  201743. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  201744. "hide_name": 0,
  201745. "bits": [ 6219 ],
  201746. "attributes": {
  201747. "abc9_carry": "00000000000000000000000000000001",
  201748. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201749. }
  201750. },
  201751. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  201752. "hide_name": 0,
  201753. "bits": [ 6217 ],
  201754. "attributes": {
  201755. "abc9_carry": "00000000000000000000000000000001",
  201756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201757. }
  201758. },
  201759. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  201760. "hide_name": 0,
  201761. "bits": [ 6214 ],
  201762. "attributes": {
  201763. "abc9_carry": "00000000000000000000000000000001",
  201764. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201765. }
  201766. },
  201767. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_RDATA": {
  201768. "hide_name": 0,
  201769. "bits": [ 6189, 6190, 6191, 6192, 6193, 6194, 6195, 6196, 6197, 6198, 6199, 6200, 6201, 6202, 6203, 6204 ],
  201770. "attributes": {
  201771. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21",
  201772. "unused_bits": "1 3 5 7 9 11 13 15"
  201773. }
  201774. },
  201775. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR": {
  201776. "hide_name": 0,
  201777. "bits": [ "0", "0", 6212, 6231 ],
  201778. "attributes": {
  201779. "force_downto": "00000000000000000000000000000001",
  201780. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201781. }
  201782. },
  201783. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_1": {
  201784. "hide_name": 0,
  201785. "bits": [ "0", "0", 6211, 6230 ],
  201786. "attributes": {
  201787. "force_downto": "00000000000000000000000000000001",
  201788. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201789. }
  201790. },
  201791. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_2": {
  201792. "hide_name": 0,
  201793. "bits": [ "0", "0", 6210, 6233 ],
  201794. "attributes": {
  201795. "force_downto": "00000000000000000000000000000001",
  201796. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201797. }
  201798. },
  201799. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_3": {
  201800. "hide_name": 0,
  201801. "bits": [ "0", "0", 6209, 6235 ],
  201802. "attributes": {
  201803. "force_downto": "00000000000000000000000000000001",
  201804. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201805. }
  201806. },
  201807. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_4": {
  201808. "hide_name": 0,
  201809. "bits": [ "0", "0", 6208, 6237 ],
  201810. "attributes": {
  201811. "force_downto": "00000000000000000000000000000001",
  201812. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201813. }
  201814. },
  201815. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_5": {
  201816. "hide_name": 0,
  201817. "bits": [ "0", "0", 6207, 6239 ],
  201818. "attributes": {
  201819. "force_downto": "00000000000000000000000000000001",
  201820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201821. }
  201822. },
  201823. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_6": {
  201824. "hide_name": 0,
  201825. "bits": [ "0", "0", 6206, 6241 ],
  201826. "attributes": {
  201827. "force_downto": "00000000000000000000000000000001",
  201828. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201829. }
  201830. },
  201831. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_7": {
  201832. "hide_name": 0,
  201833. "bits": [ "0", "0", 6205, 6213 ],
  201834. "attributes": {
  201835. "force_downto": "00000000000000000000000000000001",
  201836. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  201837. }
  201838. },
  201839. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_8": {
  201840. "hide_name": 0,
  201841. "bits": [ 6213 ],
  201842. "attributes": {
  201843. "abc9_carry": "00000000000000000000000000000001",
  201844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  201845. }
  201846. },
  201847. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_I3": {
  201848. "hide_name": 0,
  201849. "bits": [ 6231 ],
  201850. "attributes": {
  201851. "abc9_carry": "00000000000000000000000000000001",
  201852. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201853. }
  201854. },
  201855. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O": {
  201856. "hide_name": 0,
  201857. "bits": [ 6244, 6243, 6242, 6240, 6238, 6236, 6234, 6232, 6245 ],
  201858. "attributes": {
  201859. "force_downto": "00000000000000000000000000000001",
  201860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  201861. }
  201862. },
  201863. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  201864. "hide_name": 0,
  201865. "bits": [ 6239 ],
  201866. "attributes": {
  201867. "abc9_carry": "00000000000000000000000000000001",
  201868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201869. }
  201870. },
  201871. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  201872. "hide_name": 0,
  201873. "bits": [ 6237 ],
  201874. "attributes": {
  201875. "abc9_carry": "00000000000000000000000000000001",
  201876. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201877. }
  201878. },
  201879. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  201880. "hide_name": 0,
  201881. "bits": [ 6235 ],
  201882. "attributes": {
  201883. "abc9_carry": "00000000000000000000000000000001",
  201884. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201885. }
  201886. },
  201887. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  201888. "hide_name": 0,
  201889. "bits": [ 6233 ],
  201890. "attributes": {
  201891. "abc9_carry": "00000000000000000000000000000001",
  201892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201893. }
  201894. },
  201895. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  201896. "hide_name": 0,
  201897. "bits": [ 6230 ],
  201898. "attributes": {
  201899. "abc9_carry": "00000000000000000000000000000001",
  201900. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201901. }
  201902. },
  201903. "uart_I.uart_rx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  201904. "hide_name": 0,
  201905. "bits": [ 6241 ],
  201906. "attributes": {
  201907. "abc9_carry": "00000000000000000000000000000001",
  201908. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  201909. }
  201910. },
  201911. "uart_I.uart_rx_fifo_I.ram_I.rd_data": {
  201912. "hide_name": 0,
  201913. "bits": [ 6189, 6197, 6193, 6201, 6191, 6199, 6195, 6203 ],
  201914. "attributes": {
  201915. "hdlname": "uart_I uart_rx_fifo_I ram_I rd_data",
  201916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:23.27-23.34"
  201917. }
  201918. },
  201919. "uart_I.uart_rx_fifo_I.ram_I.rd_ena": {
  201920. "hide_name": 0,
  201921. "bits": [ 6174 ],
  201922. "attributes": {
  201923. "hdlname": "uart_I uart_rx_fifo_I ram_I rd_ena",
  201924. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:24.14-24.20"
  201925. }
  201926. },
  201927. "uart_I.uart_rx_fifo_I.ram_I.wr_data": {
  201928. "hide_name": 0,
  201929. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131 ],
  201930. "attributes": {
  201931. "hdlname": "uart_I uart_rx_fifo_I ram_I wr_data",
  201932. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:19.27-19.34"
  201933. }
  201934. },
  201935. "uart_I.uart_rx_fifo_I.ram_I.wr_ena": {
  201936. "hide_name": 0,
  201937. "bits": [ 6173 ],
  201938. "attributes": {
  201939. "hdlname": "uart_I uart_rx_fifo_I ram_I wr_ena",
  201940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:20.14-20.20"
  201941. }
  201942. },
  201943. "uart_I.uart_rx_fifo_I.ram_rd_data": {
  201944. "hide_name": 0,
  201945. "bits": [ 6189, 6197, 6193, 6201, 6191, 6199, 6195, 6203 ],
  201946. "attributes": {
  201947. "hdlname": "uart_I uart_rx_fifo_I ram_rd_data",
  201948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:46.20-46.31"
  201949. }
  201950. },
  201951. "uart_I.uart_rx_fifo_I.ram_rd_ena": {
  201952. "hide_name": 0,
  201953. "bits": [ 6174 ],
  201954. "attributes": {
  201955. "hdlname": "uart_I uart_rx_fifo_I ram_rd_ena",
  201956. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:47.7-47.17"
  201957. }
  201958. },
  201959. "uart_I.uart_rx_fifo_I.ram_wr_data": {
  201960. "hide_name": 0,
  201961. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131 ],
  201962. "attributes": {
  201963. "hdlname": "uart_I uart_rx_fifo_I ram_wr_data",
  201964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:42.20-42.31"
  201965. }
  201966. },
  201967. "uart_I.uart_rx_fifo_I.ram_wr_ena": {
  201968. "hide_name": 0,
  201969. "bits": [ 6173 ],
  201970. "attributes": {
  201971. "hdlname": "uart_I uart_rx_fifo_I ram_wr_ena",
  201972. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:43.7-43.17"
  201973. }
  201974. },
  201975. "uart_I.uart_rx_fifo_I.rd_data": {
  201976. "hide_name": 0,
  201977. "bits": [ 6189, 6197, 6193, 6201, 6191, 6199, 6195, 6203 ],
  201978. "attributes": {
  201979. "hdlname": "uart_I uart_rx_fifo_I rd_data",
  201980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:26.26-26.33"
  201981. }
  201982. },
  201983. "uart_I.uart_rx_fifo_I.rd_empty": {
  201984. "hide_name": 0,
  201985. "bits": [ 6475 ],
  201986. "attributes": {
  201987. "hdlname": "uart_I uart_rx_fifo_I rd_empty",
  201988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:28.14-28.22"
  201989. }
  201990. },
  201991. "uart_I.uart_rx_fifo_I.rst": {
  201992. "hide_name": 0,
  201993. "bits": [ 127 ],
  201994. "attributes": {
  201995. "hdlname": "uart_I uart_rx_fifo_I rst",
  201996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:31.14-31.17"
  201997. }
  201998. },
  201999. "uart_I.uart_rx_fifo_I.wr_data": {
  202000. "hide_name": 0,
  202001. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131 ],
  202002. "attributes": {
  202003. "hdlname": "uart_I uart_rx_fifo_I wr_data",
  202004. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:22.26-22.33"
  202005. }
  202006. },
  202007. "uart_I.uart_rx_fifo_I.wr_ena": {
  202008. "hide_name": 0,
  202009. "bits": [ 6173 ],
  202010. "attributes": {
  202011. "hdlname": "uart_I uart_rx_fifo_I wr_ena",
  202012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:23.14-23.20"
  202013. }
  202014. },
  202015. "uart_I.uart_rx_stb": {
  202016. "hide_name": 0,
  202017. "bits": [ 6140 ],
  202018. "attributes": {
  202019. "hdlname": "uart_I uart_rx_stb",
  202020. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:62.14-62.25"
  202021. }
  202022. },
  202023. "uart_I.uart_tx": {
  202024. "hide_name": 0,
  202025. "bits": [ 26 ],
  202026. "attributes": {
  202027. "hdlname": "uart_I uart_tx",
  202028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:17.14-17.21"
  202029. }
  202030. },
  202031. "uart_I.uart_tx_I.ack": {
  202032. "hide_name": 0,
  202033. "bits": [ 6258 ],
  202034. "attributes": {
  202035. "hdlname": "uart_I uart_tx_I ack",
  202036. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:18.14-18.17"
  202037. }
  202038. },
  202039. "uart_I.uart_tx_I.ack_SB_LUT4_I1_O": {
  202040. "hide_name": 0,
  202041. "bits": [ 6261 ],
  202042. "attributes": {
  202043. }
  202044. },
  202045. "uart_I.uart_tx_I.bit_cnt": {
  202046. "hide_name": 0,
  202047. "bits": [ 6271, 6269, 6267, 6273, 6264 ],
  202048. "attributes": {
  202049. "hdlname": "uart_I uart_tx_I bit_cnt",
  202050. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:29.12-29.19"
  202051. }
  202052. },
  202053. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D": {
  202054. "hide_name": 0,
  202055. "bits": [ 6270, 6268, 6266, 6272, 6262 ],
  202056. "attributes": {
  202057. "force_downto": "00000000000000000000000000000001",
  202058. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  202059. }
  202060. },
  202061. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_1_I3": {
  202062. "hide_name": 0,
  202063. "bits": [ 6274 ],
  202064. "attributes": {
  202065. "abc9_carry": "00000000000000000000000000000001",
  202066. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202067. }
  202068. },
  202069. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_2_I3": {
  202070. "hide_name": 0,
  202071. "bits": [ 6275 ],
  202072. "attributes": {
  202073. "abc9_carry": "00000000000000000000000000000001",
  202074. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202075. }
  202076. },
  202077. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_D_SB_LUT4_O_3_I3": {
  202078. "hide_name": 0,
  202079. "bits": [ 6276 ],
  202080. "attributes": {
  202081. "abc9_carry": "00000000000000000000000000000001",
  202082. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:55.15-55.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202083. }
  202084. },
  202085. "uart_I.uart_tx_I.bit_cnt_SB_DFFESS_Q_S": {
  202086. "hide_name": 0,
  202087. "bits": [ 6265 ],
  202088. "attributes": {
  202089. }
  202090. },
  202091. "uart_I.uart_tx_I.ce": {
  202092. "hide_name": 0,
  202093. "bits": [ 6279 ],
  202094. "attributes": {
  202095. "hdlname": "uart_I uart_tx_I ce",
  202096. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:25.17-25.19"
  202097. }
  202098. },
  202099. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D": {
  202100. "hide_name": 0,
  202101. "bits": [ 7248, 7249, 7250, 7251, 7252, 7253, 7254, 7255, 7256, 7257, 7258, 7259, 6278 ],
  202102. "attributes": {
  202103. "force_downto": "00000000000000000000000000000001",
  202104. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27",
  202105. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11"
  202106. }
  202107. },
  202108. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  202109. "hide_name": 0,
  202110. "bits": [ 6280 ],
  202111. "attributes": {
  202112. "abc9_carry": "00000000000000000000000000000001",
  202113. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202114. }
  202115. },
  202116. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  202117. "hide_name": 0,
  202118. "bits": [ 6281 ],
  202119. "attributes": {
  202120. "abc9_carry": "00000000000000000000000000000001",
  202121. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202122. }
  202123. },
  202124. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  202125. "hide_name": 0,
  202126. "bits": [ 6283 ],
  202127. "attributes": {
  202128. "abc9_carry": "00000000000000000000000000000001",
  202129. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202130. }
  202131. },
  202132. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  202133. "hide_name": 0,
  202134. "bits": [ 6285 ],
  202135. "attributes": {
  202136. "abc9_carry": "00000000000000000000000000000001",
  202137. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202138. }
  202139. },
  202140. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_CARRY_CO_CI": {
  202141. "hide_name": 0,
  202142. "bits": [ 6287 ],
  202143. "attributes": {
  202144. "abc9_carry": "00000000000000000000000000000001",
  202145. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202146. }
  202147. },
  202148. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_CARRY_CO_CI_SB_LUT4_I3_O": {
  202149. "hide_name": 0,
  202150. "bits": [ 6012, 6263, 6292 ],
  202151. "attributes": {
  202152. "force_downto": "00000000000000000000000000000001",
  202153. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202154. }
  202155. },
  202156. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O": {
  202157. "hide_name": 0,
  202158. "bits": [ 6011, 6263, 6293 ],
  202159. "attributes": {
  202160. "force_downto": "00000000000000000000000000000001",
  202161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202162. }
  202163. },
  202164. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  202165. "hide_name": 0,
  202166. "bits": [ 6296, 6325, 6322, 6318, 6314, 6310, 6306, 6302, 6300, 6297, 6298, 6294 ],
  202167. "attributes": {
  202168. }
  202169. },
  202170. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3": {
  202171. "hide_name": 0,
  202172. "bits": [ 6015, 6263, 6291 ],
  202173. "attributes": {
  202174. "force_downto": "00000000000000000000000000000001",
  202175. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202176. }
  202177. },
  202178. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2_I3": {
  202179. "hide_name": 0,
  202180. "bits": [ 6016, 6263, 6299 ],
  202181. "attributes": {
  202182. "force_downto": "00000000000000000000000000000001",
  202183. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202184. }
  202185. },
  202186. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3": {
  202187. "hide_name": 0,
  202188. "bits": [ 6017, 6263, 6301 ],
  202189. "attributes": {
  202190. "force_downto": "00000000000000000000000000000001",
  202191. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202192. }
  202193. },
  202194. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3_SB_LUT4_O_I3": {
  202195. "hide_name": 0,
  202196. "bits": [ 6289 ],
  202197. "attributes": {
  202198. "abc9_carry": "00000000000000000000000000000001",
  202199. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202200. }
  202201. },
  202202. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3": {
  202203. "hide_name": 0,
  202204. "bits": [ 6018, 6263, 6305 ],
  202205. "attributes": {
  202206. "force_downto": "00000000000000000000000000000001",
  202207. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202208. }
  202209. },
  202210. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3_SB_LUT4_O_I3": {
  202211. "hide_name": 0,
  202212. "bits": [ 6303 ],
  202213. "attributes": {
  202214. "abc9_carry": "00000000000000000000000000000001",
  202215. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202216. }
  202217. },
  202218. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3": {
  202219. "hide_name": 0,
  202220. "bits": [ 6019, 6263, 6309 ],
  202221. "attributes": {
  202222. "force_downto": "00000000000000000000000000000001",
  202223. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202224. }
  202225. },
  202226. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3_SB_LUT4_O_I3": {
  202227. "hide_name": 0,
  202228. "bits": [ 6307 ],
  202229. "attributes": {
  202230. "abc9_carry": "00000000000000000000000000000001",
  202231. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202232. }
  202233. },
  202234. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3": {
  202235. "hide_name": 0,
  202236. "bits": [ 6020, 6263, 6313 ],
  202237. "attributes": {
  202238. "force_downto": "00000000000000000000000000000001",
  202239. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202240. }
  202241. },
  202242. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3_SB_LUT4_O_I3": {
  202243. "hide_name": 0,
  202244. "bits": [ 6311 ],
  202245. "attributes": {
  202246. "abc9_carry": "00000000000000000000000000000001",
  202247. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202248. }
  202249. },
  202250. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3": {
  202251. "hide_name": 0,
  202252. "bits": [ 6021, 6263, 6317 ],
  202253. "attributes": {
  202254. "force_downto": "00000000000000000000000000000001",
  202255. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202256. }
  202257. },
  202258. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3_SB_LUT4_O_I3": {
  202259. "hide_name": 0,
  202260. "bits": [ 6315 ],
  202261. "attributes": {
  202262. "abc9_carry": "00000000000000000000000000000001",
  202263. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202264. }
  202265. },
  202266. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I2": {
  202267. "hide_name": 0,
  202268. "bits": [ 6022, 6321, 6263 ],
  202269. "attributes": {
  202270. "force_downto": "00000000000000000000000000000001",
  202271. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202272. }
  202273. },
  202274. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I2_SB_LUT4_O_I3": {
  202275. "hide_name": 0,
  202276. "bits": [ 6319 ],
  202277. "attributes": {
  202278. "abc9_carry": "00000000000000000000000000000001",
  202279. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:46.15-46.26|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202280. }
  202281. },
  202282. "uart_I.uart_tx_I.ce_SB_DFFSR_Q_D_SB_LUT4_O_I3_SB_CARRY_CO_CI_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_9_I2": {
  202283. "hide_name": 0,
  202284. "bits": [ 6013, 6324, 6263 ],
  202285. "attributes": {
  202286. "force_downto": "00000000000000000000000000000001",
  202287. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202288. }
  202289. },
  202290. "uart_I.uart_tx_I.ce_SB_LUT4_I0_O": {
  202291. "hide_name": 0,
  202292. "bits": [ 6326 ],
  202293. "attributes": {
  202294. }
  202295. },
  202296. "uart_I.uart_tx_I.ce_SB_LUT4_I0_O_SB_DFFR_D_Q": {
  202297. "hide_name": 0,
  202298. "bits": [ 6259, 6277 ],
  202299. "attributes": {
  202300. "force_downto": "00000000000000000000000000000001",
  202301. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202302. }
  202303. },
  202304. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O": {
  202305. "hide_name": 0,
  202306. "bits": [ 6327 ],
  202307. "attributes": {
  202308. "defaultvalue": "1",
  202309. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:58.2-64.34|/usr/bin/../share/yosys/ice40/ff_map.v:15.63-15.116|/usr/bin/../share/yosys/ice40/cells_sim.v:797.8-797.9"
  202310. }
  202311. },
  202312. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_1_Q": {
  202313. "hide_name": 0,
  202314. "bits": [ 6349, 6331, 6257 ],
  202315. "attributes": {
  202316. "force_downto": "00000000000000000000000000000001",
  202317. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202318. }
  202319. },
  202320. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_2_Q": {
  202321. "hide_name": 0,
  202322. "bits": [ 6348, 6333, 6257 ],
  202323. "attributes": {
  202324. "force_downto": "00000000000000000000000000000001",
  202325. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202326. }
  202327. },
  202328. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_3_Q": {
  202329. "hide_name": 0,
  202330. "bits": [ 6347, 6335, 6257 ],
  202331. "attributes": {
  202332. "force_downto": "00000000000000000000000000000001",
  202333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202334. }
  202335. },
  202336. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_4_Q": {
  202337. "hide_name": 0,
  202338. "bits": [ 6346, 6337, 6257 ],
  202339. "attributes": {
  202340. "force_downto": "00000000000000000000000000000001",
  202341. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202342. }
  202343. },
  202344. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_5_Q": {
  202345. "hide_name": 0,
  202346. "bits": [ 6345, 6339, 6257 ],
  202347. "attributes": {
  202348. "force_downto": "00000000000000000000000000000001",
  202349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202350. }
  202351. },
  202352. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_6_Q": {
  202353. "hide_name": 0,
  202354. "bits": [ 6344, 6341, 6257 ],
  202355. "attributes": {
  202356. "force_downto": "00000000000000000000000000000001",
  202357. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202358. }
  202359. },
  202360. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_7_Q": {
  202361. "hide_name": 0,
  202362. "bits": [ 6343, 6257 ],
  202363. "attributes": {
  202364. "force_downto": "00000000000000000000000000000001",
  202365. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202366. }
  202367. },
  202368. "uart_I.uart_tx_I.ce_SB_LUT4_I2_1_O_SB_DFFES_E_Q": {
  202369. "hide_name": 0,
  202370. "bits": [ 6350, 6329, 6257 ],
  202371. "attributes": {
  202372. "force_downto": "00000000000000000000000000000001",
  202373. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202374. }
  202375. },
  202376. "uart_I.uart_tx_I.ce_SB_LUT4_I2_O": {
  202377. "hide_name": 0,
  202378. "bits": [ 6014, 6295, 6263 ],
  202379. "attributes": {
  202380. "force_downto": "00000000000000000000000000000001",
  202381. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202382. }
  202383. },
  202384. "uart_I.uart_tx_I.clk": {
  202385. "hide_name": 0,
  202386. "bits": [ 42 ],
  202387. "attributes": {
  202388. "hdlname": "uart_I uart_tx_I clk",
  202389. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:20.14-20.17"
  202390. }
  202391. },
  202392. "uart_I.uart_tx_I.data": {
  202393. "hide_name": 0,
  202394. "bits": [ 6344, 6345, 6346, 6347, 6348, 6349, 6350, 6351 ],
  202395. "attributes": {
  202396. "hdlname": "uart_I uart_tx_I data",
  202397. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:16.20-16.24"
  202398. }
  202399. },
  202400. "uart_I.uart_tx_I.div": {
  202401. "hide_name": 0,
  202402. "bits": [ 6014, 6013, 6022, 6021, 6020, 6019, 6018, 6017, 6016, 6015, 6012, 6011 ],
  202403. "attributes": {
  202404. "hdlname": "uart_I uart_tx_I div",
  202405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:19.30-19.33"
  202406. }
  202407. },
  202408. "uart_I.uart_tx_I.div_cnt": {
  202409. "hide_name": 0,
  202410. "bits": [ 6295, 6323, 6320, 6316, 6312, 6308, 6304, 6290, 6288, 6286, 6284, 6282, 6279 ],
  202411. "attributes": {
  202412. "hdlname": "uart_I uart_tx_I div_cnt",
  202413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:28.20-28.27"
  202414. }
  202415. },
  202416. "uart_I.uart_tx_I.go": {
  202417. "hide_name": 0,
  202418. "bits": [ 6257 ],
  202419. "attributes": {
  202420. "hdlname": "uart_I uart_tx_I go",
  202421. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:25.7-25.9"
  202422. }
  202423. },
  202424. "uart_I.uart_tx_I.go_SB_LUT4_I3_O": {
  202425. "hide_name": 0,
  202426. "bits": [ 6352, 6342, 6340, 6338, 6336, 6334, 6332, 6330, 6328 ],
  202427. "attributes": {
  202428. }
  202429. },
  202430. "uart_I.uart_tx_I.rst": {
  202431. "hide_name": 0,
  202432. "bits": [ 127 ],
  202433. "attributes": {
  202434. "hdlname": "uart_I uart_tx_I rst",
  202435. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:21.14-21.17"
  202436. }
  202437. },
  202438. "uart_I.uart_tx_I.shift": {
  202439. "hide_name": 0,
  202440. "bits": [ 26, 7260, 7261, 7262, 7263, 7264, 7265, 7266, 7267, "1" ],
  202441. "attributes": {
  202442. "hdlname": "uart_I uart_tx_I shift",
  202443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:27.12-27.17",
  202444. "unused_bits": "1 2 3 4 5 6 7 8"
  202445. }
  202446. },
  202447. "uart_I.uart_tx_I.tx": {
  202448. "hide_name": 0,
  202449. "bits": [ 26 ],
  202450. "attributes": {
  202451. "hdlname": "uart_I uart_tx_I tx",
  202452. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_tx.v:15.14-15.16"
  202453. }
  202454. },
  202455. "uart_I.uart_tx_ack": {
  202456. "hide_name": 0,
  202457. "bits": [ 6258 ],
  202458. "attributes": {
  202459. "hdlname": "uart_I uart_tx_ack",
  202460. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:58.14-58.25"
  202461. }
  202462. },
  202463. "uart_I.uart_tx_data": {
  202464. "hide_name": 0,
  202465. "bits": [ 6344, 6345, 6346, 6347, 6348, 6349, 6350, 6351 ],
  202466. "attributes": {
  202467. "hdlname": "uart_I uart_tx_data",
  202468. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:56.14-56.26"
  202469. }
  202470. },
  202471. "uart_I.uart_tx_fifo_I.clk": {
  202472. "hide_name": 0,
  202473. "bits": [ 42 ],
  202474. "attributes": {
  202475. "hdlname": "uart_I uart_tx_fifo_I clk",
  202476. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:30.14-30.17"
  202477. }
  202478. },
  202479. "uart_I.uart_tx_fifo_I.full": {
  202480. "hide_name": 0,
  202481. "bits": [ 6354 ],
  202482. "attributes": {
  202483. "hdlname": "uart_I uart_tx_fifo_I full",
  202484. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:57.7-57.11"
  202485. }
  202486. },
  202487. "uart_I.uart_tx_fifo_I.full_SB_DFFR_Q_D": {
  202488. "hide_name": 0,
  202489. "bits": [ 6353 ],
  202490. "attributes": {
  202491. }
  202492. },
  202493. "uart_I.uart_tx_fifo_I.full_SB_DFFR_Q_D_SB_LUT4_O_I3": {
  202494. "hide_name": 0,
  202495. "bits": [ 6258, 6355, 6356 ],
  202496. "attributes": {
  202497. "force_downto": "00000000000000000000000000000001",
  202498. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202499. }
  202500. },
  202501. "uart_I.uart_tx_fifo_I.lvl_dec": {
  202502. "hide_name": 0,
  202503. "bits": [ 6361 ],
  202504. "attributes": {
  202505. "hdlname": "uart_I uart_tx_fifo_I lvl_dec",
  202506. "keep": "true",
  202507. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:51.25-51.32"
  202508. }
  202509. },
  202510. "uart_I.uart_tx_fifo_I.lvl_mov": {
  202511. "hide_name": 0,
  202512. "bits": [ 6364 ],
  202513. "attributes": {
  202514. "hdlname": "uart_I uart_tx_fifo_I lvl_mov",
  202515. "keep": "true",
  202516. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:52.25-52.32"
  202517. }
  202518. },
  202519. "uart_I.uart_tx_fifo_I.lvl_mov_SB_CARRY_I1_CO": {
  202520. "hide_name": 0,
  202521. "bits": [ 6362 ],
  202522. "attributes": {
  202523. "abc9_carry": "00000000000000000000000000000001",
  202524. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202525. }
  202526. },
  202527. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_I1": {
  202528. "hide_name": 0,
  202529. "bits": [ "0", 6363, 6364, "0" ],
  202530. "attributes": {
  202531. "force_downto": "00000000000000000000000000000001",
  202532. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202533. }
  202534. },
  202535. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_I1_SB_LUT4_I2_O": {
  202536. "hide_name": 0,
  202537. "bits": [ 6354, 6357, 6358, 6359 ],
  202538. "attributes": {
  202539. "force_downto": "00000000000000000000000000000001",
  202540. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202541. }
  202542. },
  202543. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O": {
  202544. "hide_name": 0,
  202545. "bits": [ 6367, 6383, 6384, 6386, 6388, 6389, 6381, 6390, 6378, 6376 ],
  202546. "attributes": {
  202547. "force_downto": "00000000000000000000000000000001",
  202548. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  202549. }
  202550. },
  202551. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_1_I1": {
  202552. "hide_name": 0,
  202553. "bits": [ "0", 6371, 6361, 6377 ],
  202554. "attributes": {
  202555. "force_downto": "00000000000000000000000000000001",
  202556. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202557. }
  202558. },
  202559. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_1_I3": {
  202560. "hide_name": 0,
  202561. "bits": [ 6377 ],
  202562. "attributes": {
  202563. "abc9_carry": "00000000000000000000000000000001",
  202564. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202565. }
  202566. },
  202567. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_2_I1": {
  202568. "hide_name": 0,
  202569. "bits": [ "0", 6373, 6361, 6380 ],
  202570. "attributes": {
  202571. "force_downto": "00000000000000000000000000000001",
  202572. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202573. }
  202574. },
  202575. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  202576. "hide_name": 0,
  202577. "bits": [ 6380 ],
  202578. "attributes": {
  202579. "abc9_carry": "00000000000000000000000000000001",
  202580. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202581. }
  202582. },
  202583. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_3_I1": {
  202584. "hide_name": 0,
  202585. "bits": [ "0", 6366, 6361, 6362 ],
  202586. "attributes": {
  202587. "force_downto": "00000000000000000000000000000001",
  202588. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202589. }
  202590. },
  202591. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_4_I1": {
  202592. "hide_name": 0,
  202593. "bits": [ "0", 6370, 6361, 6365 ],
  202594. "attributes": {
  202595. "force_downto": "00000000000000000000000000000001",
  202596. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202597. }
  202598. },
  202599. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  202600. "hide_name": 0,
  202601. "bits": [ 6365 ],
  202602. "attributes": {
  202603. "abc9_carry": "00000000000000000000000000000001",
  202604. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202605. }
  202606. },
  202607. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_5_I1": {
  202608. "hide_name": 0,
  202609. "bits": [ "0", 6369, 6361, 6385 ],
  202610. "attributes": {
  202611. "force_downto": "00000000000000000000000000000001",
  202612. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202613. }
  202614. },
  202615. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  202616. "hide_name": 0,
  202617. "bits": [ 6385 ],
  202618. "attributes": {
  202619. "abc9_carry": "00000000000000000000000000000001",
  202620. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202621. }
  202622. },
  202623. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_6_I1": {
  202624. "hide_name": 0,
  202625. "bits": [ "0", 6368, 6361, 6387 ],
  202626. "attributes": {
  202627. "force_downto": "00000000000000000000000000000001",
  202628. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202629. }
  202630. },
  202631. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  202632. "hide_name": 0,
  202633. "bits": [ 6387 ],
  202634. "attributes": {
  202635. "abc9_carry": "00000000000000000000000000000001",
  202636. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202637. }
  202638. },
  202639. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_7_I1": {
  202640. "hide_name": 0,
  202641. "bits": [ "0", 6374, 6361, 6382 ],
  202642. "attributes": {
  202643. "force_downto": "00000000000000000000000000000001",
  202644. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202645. }
  202646. },
  202647. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_7_I3": {
  202648. "hide_name": 0,
  202649. "bits": [ 6382 ],
  202650. "attributes": {
  202651. "abc9_carry": "00000000000000000000000000000001",
  202652. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202653. }
  202654. },
  202655. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_8_I1": {
  202656. "hide_name": 0,
  202657. "bits": [ "0", 6372, 6361, 6379 ],
  202658. "attributes": {
  202659. "force_downto": "00000000000000000000000000000001",
  202660. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202661. }
  202662. },
  202663. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_8_I3": {
  202664. "hide_name": 0,
  202665. "bits": [ 6379 ],
  202666. "attributes": {
  202667. "abc9_carry": "00000000000000000000000000000001",
  202668. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202669. }
  202670. },
  202671. "uart_I.uart_tx_fifo_I.lvl_mov_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  202672. "hide_name": 0,
  202673. "bits": [ 6375 ],
  202674. "attributes": {
  202675. "abc9_carry": "00000000000000000000000000000001",
  202676. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:71.13-71.51|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202677. }
  202678. },
  202679. "uart_I.uart_tx_fifo_I.ram_I.clk": {
  202680. "hide_name": 0,
  202681. "bits": [ 42 ],
  202682. "attributes": {
  202683. "hdlname": "uart_I uart_tx_fifo_I ram_I clk",
  202684. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:26.14-26.17"
  202685. }
  202686. },
  202687. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR": {
  202688. "hide_name": 0,
  202689. "bits": [ "0", "0", 6398, 6418 ],
  202690. "attributes": {
  202691. "force_downto": "00000000000000000000000000000001",
  202692. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202693. }
  202694. },
  202695. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_1": {
  202696. "hide_name": 0,
  202697. "bits": [ "0", "0", 6397, 6417 ],
  202698. "attributes": {
  202699. "force_downto": "00000000000000000000000000000001",
  202700. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202701. }
  202702. },
  202703. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_2": {
  202704. "hide_name": 0,
  202705. "bits": [ "0", "0", 6396, 6420 ],
  202706. "attributes": {
  202707. "force_downto": "00000000000000000000000000000001",
  202708. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202709. }
  202710. },
  202711. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_3": {
  202712. "hide_name": 0,
  202713. "bits": [ "0", "0", 6395, 6422 ],
  202714. "attributes": {
  202715. "force_downto": "00000000000000000000000000000001",
  202716. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202717. }
  202718. },
  202719. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_4": {
  202720. "hide_name": 0,
  202721. "bits": [ "0", "0", 6394, 6424 ],
  202722. "attributes": {
  202723. "force_downto": "00000000000000000000000000000001",
  202724. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202725. }
  202726. },
  202727. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_5": {
  202728. "hide_name": 0,
  202729. "bits": [ "0", "0", 6393, 6426 ],
  202730. "attributes": {
  202731. "force_downto": "00000000000000000000000000000001",
  202732. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202733. }
  202734. },
  202735. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_6": {
  202736. "hide_name": 0,
  202737. "bits": [ "0", "0", 6392, 6428 ],
  202738. "attributes": {
  202739. "force_downto": "00000000000000000000000000000001",
  202740. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202741. }
  202742. },
  202743. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_7": {
  202744. "hide_name": 0,
  202745. "bits": [ "0", "0", 6391, 6399 ],
  202746. "attributes": {
  202747. "force_downto": "00000000000000000000000000000001",
  202748. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202749. }
  202750. },
  202751. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_8": {
  202752. "hide_name": 0,
  202753. "bits": [ 6399 ],
  202754. "attributes": {
  202755. "abc9_carry": "00000000000000000000000000000001",
  202756. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  202757. }
  202758. },
  202759. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_I3": {
  202760. "hide_name": 0,
  202761. "bits": [ 6418 ],
  202762. "attributes": {
  202763. "abc9_carry": "00000000000000000000000000000001",
  202764. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202765. }
  202766. },
  202767. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O": {
  202768. "hide_name": 0,
  202769. "bits": [ 6431, 6430, 6429, 6427, 6425, 6423, 6421, 6419, 6432 ],
  202770. "attributes": {
  202771. "force_downto": "00000000000000000000000000000001",
  202772. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  202773. }
  202774. },
  202775. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  202776. "hide_name": 0,
  202777. "bits": [ 6426 ],
  202778. "attributes": {
  202779. "abc9_carry": "00000000000000000000000000000001",
  202780. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202781. }
  202782. },
  202783. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  202784. "hide_name": 0,
  202785. "bits": [ 6424 ],
  202786. "attributes": {
  202787. "abc9_carry": "00000000000000000000000000000001",
  202788. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202789. }
  202790. },
  202791. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  202792. "hide_name": 0,
  202793. "bits": [ 6422 ],
  202794. "attributes": {
  202795. "abc9_carry": "00000000000000000000000000000001",
  202796. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202797. }
  202798. },
  202799. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  202800. "hide_name": 0,
  202801. "bits": [ 6420 ],
  202802. "attributes": {
  202803. "abc9_carry": "00000000000000000000000000000001",
  202804. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202805. }
  202806. },
  202807. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  202808. "hide_name": 0,
  202809. "bits": [ 6417 ],
  202810. "attributes": {
  202811. "abc9_carry": "00000000000000000000000000000001",
  202812. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202813. }
  202814. },
  202815. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RADDR_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  202816. "hide_name": 0,
  202817. "bits": [ 6428 ],
  202818. "attributes": {
  202819. "abc9_carry": "00000000000000000000000000000001",
  202820. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:112.19-112.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202821. }
  202822. },
  202823. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_RDATA": {
  202824. "hide_name": 0,
  202825. "bits": [ 6344, 6400, 6348, 6401, 6346, 6402, 6350, 6403, 6345, 6404, 6349, 6405, 6347, 6406, 6351, 6407 ],
  202826. "attributes": {
  202827. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1488.16-1488.21",
  202828. "unused_bits": "1 3 5 7 9 11 13 15"
  202829. }
  202830. },
  202831. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR": {
  202832. "hide_name": 0,
  202833. "bits": [ "0", "0", 6415, 6434 ],
  202834. "attributes": {
  202835. "force_downto": "00000000000000000000000000000001",
  202836. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202837. }
  202838. },
  202839. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_1": {
  202840. "hide_name": 0,
  202841. "bits": [ "0", "0", 6414, 6433 ],
  202842. "attributes": {
  202843. "force_downto": "00000000000000000000000000000001",
  202844. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202845. }
  202846. },
  202847. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_2": {
  202848. "hide_name": 0,
  202849. "bits": [ "0", "0", 6413, 6436 ],
  202850. "attributes": {
  202851. "force_downto": "00000000000000000000000000000001",
  202852. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202853. }
  202854. },
  202855. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_3": {
  202856. "hide_name": 0,
  202857. "bits": [ "0", "0", 6412, 6438 ],
  202858. "attributes": {
  202859. "force_downto": "00000000000000000000000000000001",
  202860. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202861. }
  202862. },
  202863. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_4": {
  202864. "hide_name": 0,
  202865. "bits": [ "0", "0", 6411, 6440 ],
  202866. "attributes": {
  202867. "force_downto": "00000000000000000000000000000001",
  202868. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202869. }
  202870. },
  202871. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_5": {
  202872. "hide_name": 0,
  202873. "bits": [ "0", "0", 6410, 6442 ],
  202874. "attributes": {
  202875. "force_downto": "00000000000000000000000000000001",
  202876. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202877. }
  202878. },
  202879. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_6": {
  202880. "hide_name": 0,
  202881. "bits": [ "0", "0", 6409, 6444 ],
  202882. "attributes": {
  202883. "force_downto": "00000000000000000000000000000001",
  202884. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202885. }
  202886. },
  202887. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_7": {
  202888. "hide_name": 0,
  202889. "bits": [ "0", "0", 6408, 6416 ],
  202890. "attributes": {
  202891. "force_downto": "00000000000000000000000000000001",
  202892. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  202893. }
  202894. },
  202895. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_8": {
  202896. "hide_name": 0,
  202897. "bits": [ 6416 ],
  202898. "attributes": {
  202899. "abc9_carry": "00000000000000000000000000000001",
  202900. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  202901. }
  202902. },
  202903. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_I3": {
  202904. "hide_name": 0,
  202905. "bits": [ 6434 ],
  202906. "attributes": {
  202907. "abc9_carry": "00000000000000000000000000000001",
  202908. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202909. }
  202910. },
  202911. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O": {
  202912. "hide_name": 0,
  202913. "bits": [ 6447, 6446, 6445, 6443, 6441, 6439, 6437, 6435, 6448 ],
  202914. "attributes": {
  202915. "force_downto": "00000000000000000000000000000001",
  202916. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  202917. }
  202918. },
  202919. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_1_I3": {
  202920. "hide_name": 0,
  202921. "bits": [ 6433 ],
  202922. "attributes": {
  202923. "abc9_carry": "00000000000000000000000000000001",
  202924. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202925. }
  202926. },
  202927. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  202928. "hide_name": 0,
  202929. "bits": [ 6444 ],
  202930. "attributes": {
  202931. "abc9_carry": "00000000000000000000000000000001",
  202932. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202933. }
  202934. },
  202935. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  202936. "hide_name": 0,
  202937. "bits": [ 6442 ],
  202938. "attributes": {
  202939. "abc9_carry": "00000000000000000000000000000001",
  202940. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202941. }
  202942. },
  202943. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  202944. "hide_name": 0,
  202945. "bits": [ 6438 ],
  202946. "attributes": {
  202947. "abc9_carry": "00000000000000000000000000000001",
  202948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202949. }
  202950. },
  202951. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  202952. "hide_name": 0,
  202953. "bits": [ 6436 ],
  202954. "attributes": {
  202955. "abc9_carry": "00000000000000000000000000000001",
  202956. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202957. }
  202958. },
  202959. "uart_I.uart_tx_fifo_I.ram_I.ram.0.0_WADDR_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  202960. "hide_name": 0,
  202961. "bits": [ 6440 ],
  202962. "attributes": {
  202963. "abc9_carry": "00000000000000000000000000000001",
  202964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:99.19-99.34|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  202965. }
  202966. },
  202967. "uart_I.uart_tx_fifo_I.ram_I.rd_data": {
  202968. "hide_name": 0,
  202969. "bits": [ 6344, 6345, 6346, 6347, 6348, 6349, 6350, 6351 ],
  202970. "attributes": {
  202971. "hdlname": "uart_I uart_tx_fifo_I ram_I rd_data",
  202972. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:23.27-23.34"
  202973. }
  202974. },
  202975. "uart_I.uart_tx_fifo_I.ram_I.rd_ena": {
  202976. "hide_name": 0,
  202977. "bits": [ 6360 ],
  202978. "attributes": {
  202979. "hdlname": "uart_I uart_tx_fifo_I ram_I rd_ena",
  202980. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:24.14-24.20"
  202981. }
  202982. },
  202983. "uart_I.uart_tx_fifo_I.ram_I.wr_data": {
  202984. "hide_name": 0,
  202985. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74 ],
  202986. "attributes": {
  202987. "hdlname": "uart_I uart_tx_fifo_I ram_I wr_data",
  202988. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:19.27-19.34"
  202989. }
  202990. },
  202991. "uart_I.uart_tx_fifo_I.ram_I.wr_ena": {
  202992. "hide_name": 0,
  202993. "bits": [ 6355 ],
  202994. "attributes": {
  202995. "hdlname": "uart_I uart_tx_fifo_I ram_I wr_ena",
  202996. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/ram_sdp.v:20.14-20.20"
  202997. }
  202998. },
  202999. "uart_I.uart_tx_fifo_I.ram_rd_data": {
  203000. "hide_name": 0,
  203001. "bits": [ 6344, 6345, 6346, 6347, 6348, 6349, 6350, 6351 ],
  203002. "attributes": {
  203003. "hdlname": "uart_I uart_tx_fifo_I ram_rd_data",
  203004. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:46.20-46.31"
  203005. }
  203006. },
  203007. "uart_I.uart_tx_fifo_I.ram_rd_ena": {
  203008. "hide_name": 0,
  203009. "bits": [ 6360 ],
  203010. "attributes": {
  203011. "hdlname": "uart_I uart_tx_fifo_I ram_rd_ena",
  203012. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:47.7-47.17"
  203013. }
  203014. },
  203015. "uart_I.uart_tx_fifo_I.ram_rd_ena_SB_LUT4_O_I3": {
  203016. "hide_name": 0,
  203017. "bits": [ 6258, 6259, 6260 ],
  203018. "attributes": {
  203019. "force_downto": "00000000000000000000000000000001",
  203020. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203021. }
  203022. },
  203023. "uart_I.uart_tx_fifo_I.ram_wr_data": {
  203024. "hide_name": 0,
  203025. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74 ],
  203026. "attributes": {
  203027. "hdlname": "uart_I uart_tx_fifo_I ram_wr_data",
  203028. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:42.20-42.31"
  203029. }
  203030. },
  203031. "uart_I.uart_tx_fifo_I.ram_wr_ena": {
  203032. "hide_name": 0,
  203033. "bits": [ 6355 ],
  203034. "attributes": {
  203035. "hdlname": "uart_I uart_tx_fifo_I ram_wr_ena",
  203036. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:43.7-43.17"
  203037. }
  203038. },
  203039. "uart_I.uart_tx_fifo_I.rd_data": {
  203040. "hide_name": 0,
  203041. "bits": [ 6344, 6345, 6346, 6347, 6348, 6349, 6350, 6351 ],
  203042. "attributes": {
  203043. "hdlname": "uart_I uart_tx_fifo_I rd_data",
  203044. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:26.26-26.33"
  203045. }
  203046. },
  203047. "uart_I.uart_tx_fifo_I.rd_empty": {
  203048. "hide_name": 0,
  203049. "bits": [ 6461 ],
  203050. "attributes": {
  203051. "hdlname": "uart_I uart_tx_fifo_I rd_empty",
  203052. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:28.14-28.22"
  203053. }
  203054. },
  203055. "uart_I.uart_tx_fifo_I.rd_ena": {
  203056. "hide_name": 0,
  203057. "bits": [ 6258 ],
  203058. "attributes": {
  203059. "hdlname": "uart_I uart_tx_fifo_I rd_ena",
  203060. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:27.14-27.20"
  203061. }
  203062. },
  203063. "uart_I.uart_tx_fifo_I.rst": {
  203064. "hide_name": 0,
  203065. "bits": [ 127 ],
  203066. "attributes": {
  203067. "hdlname": "uart_I uart_tx_fifo_I rst",
  203068. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:31.14-31.17"
  203069. }
  203070. },
  203071. "uart_I.uart_tx_fifo_I.wr_data": {
  203072. "hide_name": 0,
  203073. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74 ],
  203074. "attributes": {
  203075. "hdlname": "uart_I uart_tx_fifo_I wr_data",
  203076. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:22.26-22.33"
  203077. }
  203078. },
  203079. "uart_I.uart_tx_fifo_I.wr_ena": {
  203080. "hide_name": 0,
  203081. "bits": [ 6355 ],
  203082. "attributes": {
  203083. "hdlname": "uart_I uart_tx_fifo_I wr_ena",
  203084. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:23.14-23.20"
  203085. }
  203086. },
  203087. "uart_I.uart_tx_fifo_I.wr_full": {
  203088. "hide_name": 0,
  203089. "bits": [ 6354 ],
  203090. "attributes": {
  203091. "hdlname": "uart_I uart_tx_fifo_I wr_full",
  203092. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/fifo_sync_ram.v:24.14-24.21"
  203093. }
  203094. },
  203095. "uart_I.ub_ack": {
  203096. "hide_name": 0,
  203097. "bits": [ 5979 ],
  203098. "attributes": {
  203099. "hdlname": "uart_I ub_ack",
  203100. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:74.16-74.22"
  203101. }
  203102. },
  203103. "uart_I.ub_ack_SB_DFFSR_Q_D": {
  203104. "hide_name": 0,
  203105. "bits": [ 6449 ],
  203106. "attributes": {
  203107. }
  203108. },
  203109. "uart_I.ub_ack_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  203110. "hide_name": 0,
  203111. "bits": [ 6450, 6451 ],
  203112. "attributes": {
  203113. "force_downto": "00000000000000000000000000000001",
  203114. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203115. }
  203116. },
  203117. "uart_I.ub_rd_ctrl": {
  203118. "hide_name": 0,
  203119. "bits": [ 6453 ],
  203120. "attributes": {
  203121. "hdlname": "uart_I ub_rd_ctrl",
  203122. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:71.16-71.26"
  203123. }
  203124. },
  203125. "uart_I.ub_rd_ctrl_SB_DFFSR_Q_D": {
  203126. "hide_name": 0,
  203127. "bits": [ 6452 ],
  203128. "attributes": {
  203129. }
  203130. },
  203131. "uart_I.ub_rd_ctrl_SB_LUT4_I2_O": {
  203132. "hide_name": 0,
  203133. "bits": [ 6140, 6170, 6171 ],
  203134. "attributes": {
  203135. "force_downto": "00000000000000000000000000000001",
  203136. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203137. }
  203138. },
  203139. "uart_I.ub_rd_data": {
  203140. "hide_name": 0,
  203141. "bits": [ 6255 ],
  203142. "attributes": {
  203143. "hdlname": "uart_I ub_rd_data",
  203144. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:70.16-70.26"
  203145. }
  203146. },
  203147. "uart_I.ub_rd_data_SB_DFFSR_Q_D": {
  203148. "hide_name": 0,
  203149. "bits": [ 6456 ],
  203150. "attributes": {
  203151. }
  203152. },
  203153. "uart_I.ub_rd_data_SB_LUT4_I1_1_I2": {
  203154. "hide_name": 0,
  203155. "bits": [ 6140, 6170 ],
  203156. "attributes": {
  203157. "force_downto": "00000000000000000000000000000001",
  203158. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203159. }
  203160. },
  203161. "uart_I.ub_rd_data_SB_LUT4_I1_1_I3": {
  203162. "hide_name": 0,
  203163. "bits": [ 6254, 6255, 6170, 6458 ],
  203164. "attributes": {
  203165. "force_downto": "00000000000000000000000000000001",
  203166. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203167. }
  203168. },
  203169. "uart_I.ub_rd_data_SB_LUT4_I1_1_O": {
  203170. "hide_name": 0,
  203171. "bits": [ 6459 ],
  203172. "attributes": {
  203173. }
  203174. },
  203175. "uart_I.ub_rd_data_SB_LUT4_I1_O": {
  203176. "hide_name": 0,
  203177. "bits": [ 6457 ],
  203178. "attributes": {
  203179. }
  203180. },
  203181. "uart_I.ub_rd_data_SB_LUT4_I1_O_SB_DFFR_D_Q": {
  203182. "hide_name": 0,
  203183. "bits": [ 6254, 6255, 6256, 6143 ],
  203184. "attributes": {
  203185. "force_downto": "00000000000000000000000000000001",
  203186. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203187. }
  203188. },
  203189. "uart_I.ub_rdata": {
  203190. "hide_name": 0,
  203191. "bits": [ 6469, 6468, 6467, 6466, 6465, 6463, 6477, 6476, 6474, 6473, 6472, 6471, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 6470, 6462, 6454, 6254 ],
  203192. "attributes": {
  203193. "hdlname": "uart_I ub_rdata",
  203194. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:69.16-69.24"
  203195. }
  203196. },
  203197. "uart_I.ub_rdata_SB_DFFSR_Q_9_D": {
  203198. "hide_name": 0,
  203199. "bits": [ 6253, 6247, 6248, 6249, 6250, 6251, 6252, 6246 ],
  203200. "attributes": {
  203201. }
  203202. },
  203203. "uart_I.ub_rdata_SB_DFFSR_Q_9_R": {
  203204. "hide_name": 0,
  203205. "bits": [ 706, 6464 ],
  203206. "attributes": {
  203207. "force_downto": "00000000000000000000000000000001",
  203208. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203209. }
  203210. },
  203211. "uart_I.ub_rdata_SB_DFFSR_Q_R": {
  203212. "hide_name": 0,
  203213. "bits": [ 6460 ],
  203214. "attributes": {
  203215. }
  203216. },
  203217. "uart_I.ub_wr_data": {
  203218. "hide_name": 0,
  203219. "bits": [ 6355 ],
  203220. "attributes": {
  203221. "hdlname": "uart_I ub_wr_data",
  203222. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:72.16-72.26"
  203223. }
  203224. },
  203225. "uart_I.ub_wr_data_SB_DFFSR_Q_D": {
  203226. "hide_name": 0,
  203227. "bits": [ 6507 ],
  203228. "attributes": {
  203229. }
  203230. },
  203231. "uart_I.ub_wr_data_SB_DFFSR_Q_D_SB_LUT4_O_I3": {
  203232. "hide_name": 0,
  203233. "bits": [ 6354, 6508 ],
  203234. "attributes": {
  203235. "force_downto": "00000000000000000000000000000001",
  203236. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203237. }
  203238. },
  203239. "uart_I.ub_wr_div": {
  203240. "hide_name": 0,
  203241. "bits": [ 6010 ],
  203242. "attributes": {
  203243. "hdlname": "uart_I ub_wr_div",
  203244. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:73.16-73.25"
  203245. }
  203246. },
  203247. "uart_I.ub_wr_div_SB_DFFSR_Q_D": {
  203248. "hide_name": 0,
  203249. "bits": [ 6509 ],
  203250. "attributes": {
  203251. }
  203252. },
  203253. "uart_I.urf_empty": {
  203254. "hide_name": 0,
  203255. "bits": [ 6475 ],
  203256. "attributes": {
  203257. "hdlname": "uart_I urf_empty",
  203258. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:42.14-42.23"
  203259. }
  203260. },
  203261. "uart_I.urf_overflow": {
  203262. "hide_name": 0,
  203263. "bits": [ 6455 ],
  203264. "attributes": {
  203265. "hdlname": "uart_I urf_overflow",
  203266. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:44.14-44.26"
  203267. }
  203268. },
  203269. "uart_I.urf_overflow_SB_DFFR_Q_D": {
  203270. "hide_name": 0,
  203271. "bits": [ 6172 ],
  203272. "attributes": {
  203273. }
  203274. },
  203275. "uart_I.urf_rdata": {
  203276. "hide_name": 0,
  203277. "bits": [ 6189, 6197, 6193, 6201, 6191, 6199, 6195, 6203 ],
  203278. "attributes": {
  203279. "hdlname": "uart_I urf_rdata",
  203280. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:40.14-40.23"
  203281. }
  203282. },
  203283. "uart_I.urf_wdata": {
  203284. "hide_name": 0,
  203285. "bits": [ 6138, 6137, 6136, 6135, 6134, 6133, 6132, 6131 ],
  203286. "attributes": {
  203287. "hdlname": "uart_I urf_wdata",
  203288. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:37.14-37.23"
  203289. }
  203290. },
  203291. "uart_I.urf_wren": {
  203292. "hide_name": 0,
  203293. "bits": [ 6173 ],
  203294. "attributes": {
  203295. "hdlname": "uart_I urf_wren",
  203296. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:38.14-38.22"
  203297. }
  203298. },
  203299. "uart_I.utf_empty": {
  203300. "hide_name": 0,
  203301. "bits": [ 6461 ],
  203302. "attributes": {
  203303. "hdlname": "uart_I utf_empty",
  203304. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:53.14-53.23"
  203305. }
  203306. },
  203307. "uart_I.utf_full": {
  203308. "hide_name": 0,
  203309. "bits": [ 6354 ],
  203310. "attributes": {
  203311. "hdlname": "uart_I utf_full",
  203312. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:50.14-50.22"
  203313. }
  203314. },
  203315. "uart_I.utf_rdata": {
  203316. "hide_name": 0,
  203317. "bits": [ 6344, 6345, 6346, 6347, 6348, 6349, 6350, 6351 ],
  203318. "attributes": {
  203319. "hdlname": "uart_I utf_rdata",
  203320. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:51.14-51.23"
  203321. }
  203322. },
  203323. "uart_I.utf_rden": {
  203324. "hide_name": 0,
  203325. "bits": [ 6258 ],
  203326. "attributes": {
  203327. "hdlname": "uart_I utf_rden",
  203328. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:52.14-52.22"
  203329. }
  203330. },
  203331. "uart_I.utf_wdata": {
  203332. "hide_name": 0,
  203333. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74 ],
  203334. "attributes": {
  203335. "hdlname": "uart_I utf_wdata",
  203336. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:48.14-48.23"
  203337. }
  203338. },
  203339. "uart_I.utf_wren": {
  203340. "hide_name": 0,
  203341. "bits": [ 6355 ],
  203342. "attributes": {
  203343. "hdlname": "uart_I utf_wren",
  203344. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:49.14-49.22"
  203345. }
  203346. },
  203347. "uart_I.wb_ack": {
  203348. "hide_name": 0,
  203349. "bits": [ 5979 ],
  203350. "attributes": {
  203351. "hdlname": "uart_I wb_ack",
  203352. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:26.23-26.29"
  203353. }
  203354. },
  203355. "uart_I.wb_addr": {
  203356. "hide_name": 0,
  203357. "bits": [ 706, 704 ],
  203358. "attributes": {
  203359. "hdlname": "uart_I wb_addr",
  203360. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:21.23-21.30"
  203361. }
  203362. },
  203363. "uart_I.wb_cyc": {
  203364. "hide_name": 0,
  203365. "bits": [ 6450 ],
  203366. "attributes": {
  203367. "hdlname": "uart_I wb_cyc",
  203368. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:25.23-25.29"
  203369. }
  203370. },
  203371. "uart_I.wb_cyc_SB_DFFSR_Q_D": {
  203372. "hide_name": 0,
  203373. "bits": [ 6510 ],
  203374. "attributes": {
  203375. }
  203376. },
  203377. "uart_I.wb_rdata": {
  203378. "hide_name": 0,
  203379. "bits": [ 6469, 6468, 6467, 6466, 6465, 6463, 6477, 6476, 6474, 6473, 6472, 6471, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 6470, 6462, 6454, 6254 ],
  203380. "attributes": {
  203381. "hdlname": "uart_I wb_rdata",
  203382. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:22.23-22.31"
  203383. }
  203384. },
  203385. "uart_I.wb_wdata": {
  203386. "hide_name": 0,
  203387. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  203388. "attributes": {
  203389. "hdlname": "uart_I wb_wdata",
  203390. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:23.23-23.31"
  203391. }
  203392. },
  203393. "uart_I.wb_we": {
  203394. "hide_name": 0,
  203395. "bits": [ 469 ],
  203396. "attributes": {
  203397. "hdlname": "uart_I wb_we",
  203398. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/uart_wb.v:24.23-24.28"
  203399. }
  203400. },
  203401. "uart_rx": {
  203402. "hide_name": 0,
  203403. "bits": [ 25 ],
  203404. "attributes": {
  203405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:28.14-28.21"
  203406. }
  203407. },
  203408. "uart_tx": {
  203409. "hide_name": 0,
  203410. "bits": [ 26 ],
  203411. "attributes": {
  203412. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:29.14-29.21"
  203413. }
  203414. },
  203415. "vex_externalInterruptArray": {
  203416. "hide_name": 0,
  203417. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  203418. "attributes": {
  203419. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:58.14-58.40"
  203420. }
  203421. },
  203422. "vex_externalResetVector": {
  203423. "hide_name": 0,
  203424. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  203425. "attributes": {
  203426. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:55.14-55.37"
  203427. }
  203428. },
  203429. "vex_softwareInterrupt": {
  203430. "hide_name": 0,
  203431. "bits": [ "0" ],
  203432. "attributes": {
  203433. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:57.14-57.35"
  203434. }
  203435. },
  203436. "vex_timerInterrupt": {
  203437. "hide_name": 0,
  203438. "bits": [ "0" ],
  203439. "attributes": {
  203440. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:56.14-56.32"
  203441. }
  203442. },
  203443. "vid_I.clk": {
  203444. "hide_name": 0,
  203445. "bits": [ 42 ],
  203446. "attributes": {
  203447. "hdlname": "vid_I clk",
  203448. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:41.21-41.24"
  203449. }
  203450. },
  203451. "vid_I.dly_de.clk": {
  203452. "hide_name": 0,
  203453. "bits": [ 42 ],
  203454. "attributes": {
  203455. "hdlname": "vid_I dly_de clk",
  203456. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:23.14-23.17"
  203457. }
  203458. },
  203459. "vid_I.dly_de.d": {
  203460. "hide_name": 0,
  203461. "bits": [ 6609 ],
  203462. "attributes": {
  203463. "hdlname": "vid_I dly_de d",
  203464. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:21.14-21.15"
  203465. }
  203466. },
  203467. "vid_I.dly_de.dl": {
  203468. "hide_name": 0,
  203469. "bits": [ 6513, 6511, 6512, 6514 ],
  203470. "attributes": {
  203471. "hdlname": "vid_I dly_de dl",
  203472. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:26.18-26.20"
  203473. }
  203474. },
  203475. "vid_I.dly_de.q": {
  203476. "hide_name": 0,
  203477. "bits": [ 6514 ],
  203478. "attributes": {
  203479. "hdlname": "vid_I dly_de q",
  203480. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:22.14-22.15"
  203481. }
  203482. },
  203483. "vid_I.dly_hsync.clk": {
  203484. "hide_name": 0,
  203485. "bits": [ 42 ],
  203486. "attributes": {
  203487. "hdlname": "vid_I dly_hsync clk",
  203488. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:23.14-23.17"
  203489. }
  203490. },
  203491. "vid_I.dly_hsync.d": {
  203492. "hide_name": 0,
  203493. "bits": [ 6516 ],
  203494. "attributes": {
  203495. "hdlname": "vid_I dly_hsync d",
  203496. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:21.14-21.15"
  203497. }
  203498. },
  203499. "vid_I.dly_hsync.d_SB_LUT4_O_I3": {
  203500. "hide_name": 0,
  203501. "bits": [ 6515 ],
  203502. "attributes": {
  203503. "force_downto": "00000000000000000000000000000001",
  203504. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203505. }
  203506. },
  203507. "vid_I.dly_hsync.d_SB_LUT4_O_I3_SB_DFFR_Q_D": {
  203508. "hide_name": 0,
  203509. "bits": [ "0", "0", "0", 7268, 7268, 7268, "0", 6517, "0" ],
  203510. "attributes": {
  203511. "force_downto": "00000000000000000000000000000001",
  203512. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:0.0-0.0|/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:113.4-118.11|/usr/bin/../share/yosys/techmap.v:583.28-583.35",
  203513. "unused_bits": "3 4 5"
  203514. }
  203515. },
  203516. "vid_I.dly_hsync.dl": {
  203517. "hide_name": 0,
  203518. "bits": [ 6522, 6520, 6521, 6523 ],
  203519. "attributes": {
  203520. "hdlname": "vid_I dly_hsync dl",
  203521. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:26.18-26.20"
  203522. }
  203523. },
  203524. "vid_I.dly_hsync.q": {
  203525. "hide_name": 0,
  203526. "bits": [ 6523 ],
  203527. "attributes": {
  203528. "hdlname": "vid_I dly_hsync q",
  203529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:22.14-22.15"
  203530. }
  203531. },
  203532. "vid_I.dly_vsync.clk": {
  203533. "hide_name": 0,
  203534. "bits": [ 42 ],
  203535. "attributes": {
  203536. "hdlname": "vid_I dly_vsync clk",
  203537. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:23.14-23.17"
  203538. }
  203539. },
  203540. "vid_I.dly_vsync.d": {
  203541. "hide_name": 0,
  203542. "bits": [ 6525 ],
  203543. "attributes": {
  203544. "hdlname": "vid_I dly_vsync d",
  203545. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:21.14-21.15"
  203546. }
  203547. },
  203548. "vid_I.dly_vsync.d_SB_LUT4_O_I3": {
  203549. "hide_name": 0,
  203550. "bits": [ 6524 ],
  203551. "attributes": {
  203552. "force_downto": "00000000000000000000000000000001",
  203553. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203554. }
  203555. },
  203556. "vid_I.dly_vsync.dl": {
  203557. "hide_name": 0,
  203558. "bits": [ 6529, 6527, 6528, 6530 ],
  203559. "attributes": {
  203560. "hdlname": "vid_I dly_vsync dl",
  203561. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:26.18-26.20"
  203562. }
  203563. },
  203564. "vid_I.dly_vsync.q": {
  203565. "hide_name": 0,
  203566. "bits": [ 6530 ],
  203567. "attributes": {
  203568. "hdlname": "vid_I dly_vsync q",
  203569. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/delay.v:22.14-22.15"
  203570. }
  203571. },
  203572. "vid_I.fb_I.a_addr_0": {
  203573. "hide_name": 0,
  203574. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685 ],
  203575. "attributes": {
  203576. "hdlname": "vid_I fb_I a_addr_0",
  203577. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:21.21-21.29"
  203578. }
  203579. },
  203580. "vid_I.fb_I.a_rdata_1": {
  203581. "hide_name": 0,
  203582. "bits": [ 6489, 6478, 6481, 6491, 6493, 6495, 6497, 6499, 6501, 6503, 6505, 6483, 6545, 6546, 6547, 6548, 6567, 6568, 6569, 6570, 6571, 6572, 6573, 6574, 6575, 6576, 6577, 6578, 6485, 6486, 6487, 6488 ],
  203583. "attributes": {
  203584. "hdlname": "vid_I fb_I a_rdata_1",
  203585. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:22.21-22.30"
  203586. }
  203587. },
  203588. "vid_I.fb_I.a_wdata_0": {
  203589. "hide_name": 0,
  203590. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  203591. "attributes": {
  203592. "hdlname": "vid_I fb_I a_wdata_0",
  203593. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:23.21-23.30"
  203594. }
  203595. },
  203596. "vid_I.fb_I.clk": {
  203597. "hide_name": 0,
  203598. "bits": [ 42 ],
  203599. "attributes": {
  203600. "hdlname": "vid_I fb_I clk",
  203601. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:29.14-29.17"
  203602. }
  203603. },
  203604. "vid_I.fb_I.ram_rdata": {
  203605. "hide_name": 0,
  203606. "bits": [ 6489, 6478, 6481, 6491, 6493, 6495, 6497, 6499, 6501, 6503, 6505, 6483, 6545, 6546, 6547, 6548, 6567, 6568, 6569, 6570, 6571, 6572, 6573, 6574, 6575, 6576, 6577, 6578, 6485, 6486, 6487, 6488 ],
  203607. "attributes": {
  203608. "hdlname": "vid_I fb_I ram_rdata",
  203609. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:36.14-36.23"
  203610. }
  203611. },
  203612. "vid_I.fb_I.ram_wdata": {
  203613. "hide_name": 0,
  203614. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  203615. "attributes": {
  203616. "hdlname": "vid_I fb_I ram_wdata",
  203617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:37.14-37.23"
  203618. }
  203619. },
  203620. "vid_I.fb_I.spram_I[0]_ADDRESS": {
  203621. "hide_name": 0,
  203622. "bits": [ 6544 ],
  203623. "attributes": {
  203624. }
  203625. },
  203626. "vid_I.fb_I.spram_I[0]_ADDRESS_1": {
  203627. "hide_name": 0,
  203628. "bits": [ 6543 ],
  203629. "attributes": {
  203630. }
  203631. },
  203632. "vid_I.fb_I.spram_I[0]_ADDRESS_10": {
  203633. "hide_name": 0,
  203634. "bits": [ 6534 ],
  203635. "attributes": {
  203636. }
  203637. },
  203638. "vid_I.fb_I.spram_I[0]_ADDRESS_11": {
  203639. "hide_name": 0,
  203640. "bits": [ 6533 ],
  203641. "attributes": {
  203642. }
  203643. },
  203644. "vid_I.fb_I.spram_I[0]_ADDRESS_12": {
  203645. "hide_name": 0,
  203646. "bits": [ 6532 ],
  203647. "attributes": {
  203648. }
  203649. },
  203650. "vid_I.fb_I.spram_I[0]_ADDRESS_13": {
  203651. "hide_name": 0,
  203652. "bits": [ 6531 ],
  203653. "attributes": {
  203654. }
  203655. },
  203656. "vid_I.fb_I.spram_I[0]_ADDRESS_2": {
  203657. "hide_name": 0,
  203658. "bits": [ 6542 ],
  203659. "attributes": {
  203660. }
  203661. },
  203662. "vid_I.fb_I.spram_I[0]_ADDRESS_3": {
  203663. "hide_name": 0,
  203664. "bits": [ 6541 ],
  203665. "attributes": {
  203666. }
  203667. },
  203668. "vid_I.fb_I.spram_I[0]_ADDRESS_4": {
  203669. "hide_name": 0,
  203670. "bits": [ 6540 ],
  203671. "attributes": {
  203672. }
  203673. },
  203674. "vid_I.fb_I.spram_I[0]_ADDRESS_5": {
  203675. "hide_name": 0,
  203676. "bits": [ 6539 ],
  203677. "attributes": {
  203678. }
  203679. },
  203680. "vid_I.fb_I.spram_I[0]_ADDRESS_6": {
  203681. "hide_name": 0,
  203682. "bits": [ 6538 ],
  203683. "attributes": {
  203684. }
  203685. },
  203686. "vid_I.fb_I.spram_I[0]_ADDRESS_7": {
  203687. "hide_name": 0,
  203688. "bits": [ 6537 ],
  203689. "attributes": {
  203690. }
  203691. },
  203692. "vid_I.fb_I.spram_I[0]_ADDRESS_8": {
  203693. "hide_name": 0,
  203694. "bits": [ 6536 ],
  203695. "attributes": {
  203696. }
  203697. },
  203698. "vid_I.fb_I.spram_I[0]_ADDRESS_9": {
  203699. "hide_name": 0,
  203700. "bits": [ 6535 ],
  203701. "attributes": {
  203702. }
  203703. },
  203704. "vid_I.fb_I.spram_I[0]_MASKWREN": {
  203705. "hide_name": 0,
  203706. "bits": [ 121, 227 ],
  203707. "attributes": {
  203708. "force_downto": "00000000000000000000000000000001",
  203709. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203710. }
  203711. },
  203712. "vid_I.fb_I.spram_I[0]_MASKWREN_1": {
  203713. "hide_name": 0,
  203714. "bits": [ 228, 121 ],
  203715. "attributes": {
  203716. "force_downto": "00000000000000000000000000000001",
  203717. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203718. }
  203719. },
  203720. "vid_I.fb_I.spram_I[0]_MASKWREN_SB_LUT4_O_I3": {
  203721. "hide_name": 0,
  203722. "bits": [ 469, 6565 ],
  203723. "attributes": {
  203724. "force_downto": "00000000000000000000000000000001",
  203725. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203726. }
  203727. },
  203728. "vid_I.fb_I.spram_I[0]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  203729. "hide_name": 0,
  203730. "bits": [ 32, 33, 32, 33, 32, 33, 32, 33, 32, 33, 32, 33, 32, 33, 32, 33 ],
  203731. "attributes": {
  203732. "defaultvalue": "0000000000000000",
  203733. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  203734. }
  203735. },
  203736. "vid_I.fb_I.spram_I[0]_WREN": {
  203737. "hide_name": 0,
  203738. "bits": [ 6549 ],
  203739. "attributes": {
  203740. }
  203741. },
  203742. "vid_I.fb_I.spram_I[1]_MASKWREN": {
  203743. "hide_name": 0,
  203744. "bits": [ 121, 229 ],
  203745. "attributes": {
  203746. "force_downto": "00000000000000000000000000000001",
  203747. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203748. }
  203749. },
  203750. "vid_I.fb_I.spram_I[1]_MASKWREN_1": {
  203751. "hide_name": 0,
  203752. "bits": [ 121, 226 ],
  203753. "attributes": {
  203754. "force_downto": "00000000000000000000000000000001",
  203755. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203756. }
  203757. },
  203758. "vid_I.fb_I.spram_I[1]_MASKWREN_1_SB_LUT4_O_I3": {
  203759. "hide_name": 0,
  203760. "bits": [ 469, 914, 6579 ],
  203761. "attributes": {
  203762. "force_downto": "00000000000000000000000000000001",
  203763. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203764. }
  203765. },
  203766. "vid_I.fb_I.spram_I[1]_MASKWREN_SB_LUT4_O_I3": {
  203767. "hide_name": 0,
  203768. "bits": [ 469, 914, 6580 ],
  203769. "attributes": {
  203770. "force_downto": "00000000000000000000000000000001",
  203771. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  203772. }
  203773. },
  203774. "vid_I.fb_I.spram_I[1]_MASKWREN_SB_LUT4_O_I3_SB_LUT4_I3_O": {
  203775. "hide_name": 0,
  203776. "bits": [ 76, 77, 76, 77, 76, 77, 76, 77, 76, 77, 76, 77, 76, 77, 76, 77 ],
  203777. "attributes": {
  203778. "defaultvalue": "0000000000000000",
  203779. "src": "/usr/bin/../share/yosys/ice40/brams_map.v:204.532-204.765|/usr/bin/../share/yosys/ice40/cells_sim.v:1497.16-1497.20"
  203780. }
  203781. },
  203782. "vid_I.fb_I.v_addr_0": {
  203783. "hide_name": 0,
  203784. "bits": [ 6554, 6553, 6552, 6550, 6563, 6562, 6561, 6560, 6559, 6558, 6557, 6556, 6555, 6564 ],
  203785. "attributes": {
  203786. "hdlname": "vid_I fb_I v_addr_0",
  203787. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:16.21-16.29"
  203788. }
  203789. },
  203790. "vid_I.fb_I.v_data_1": {
  203791. "hide_name": 0,
  203792. "bits": [ 6489, 6478, 6481, 6491, 6493, 6495, 6497, 6499, 6501, 6503, 6505, 6483, 6545, 6546, 6547, 6548, 6567, 6568, 6569, 6570, 6571, 6572, 6573, 6574, 6575, 6576, 6577, 6578, 6485, 6486, 6487, 6488 ],
  203793. "attributes": {
  203794. "hdlname": "vid_I fb_I v_data_1",
  203795. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:17.21-17.29"
  203796. }
  203797. },
  203798. "vid_I.fb_I.v_re_0": {
  203799. "hide_name": 0,
  203800. "bits": [ 6551 ],
  203801. "attributes": {
  203802. "hdlname": "vid_I fb_I v_re_0",
  203803. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_framebuf.v:18.21-18.27"
  203804. }
  203805. },
  203806. "vid_I.fb_a_addr_0": {
  203807. "hide_name": 0,
  203808. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685 ],
  203809. "attributes": {
  203810. "hdlname": "vid_I fb_a_addr_0",
  203811. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:52.14-52.25"
  203812. }
  203813. },
  203814. "vid_I.fb_a_rdata_1": {
  203815. "hide_name": 0,
  203816. "bits": [ 6489, 6478, 6481, 6491, 6493, 6495, 6497, 6499, 6501, 6503, 6505, 6483, 6545, 6546, 6547, 6548, 6567, 6568, 6569, 6570, 6571, 6572, 6573, 6574, 6575, 6576, 6577, 6578, 6485, 6486, 6487, 6488 ],
  203817. "attributes": {
  203818. "hdlname": "vid_I fb_a_rdata_1",
  203819. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:53.14-53.26"
  203820. }
  203821. },
  203822. "vid_I.fb_a_wdata_0": {
  203823. "hide_name": 0,
  203824. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  203825. "attributes": {
  203826. "hdlname": "vid_I fb_a_wdata_0",
  203827. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:54.14-54.26"
  203828. }
  203829. },
  203830. "vid_I.fb_v_addr_0": {
  203831. "hide_name": 0,
  203832. "bits": [ 6554, 6553, 6552, 6550, 6563, 6562, 6561, 6560, 6559, 6558, 6557, 6556, 6555, 6564 ],
  203833. "attributes": {
  203834. "hdlname": "vid_I fb_v_addr_0",
  203835. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:49.14-49.25"
  203836. }
  203837. },
  203838. "vid_I.fb_v_data_1": {
  203839. "hide_name": 0,
  203840. "bits": [ 6489, 6478, 6481, 6491, 6493, 6495, 6497, 6499, 6501, 6503, 6505, 6483, 6545, 6546, 6547, 6548, 6567, 6568, 6569, 6570, 6571, 6572, 6573, 6574, 6575, 6576, 6577, 6578, 6485, 6486, 6487, 6488 ],
  203841. "attributes": {
  203842. "hdlname": "vid_I fb_v_data_1",
  203843. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:50.14-50.25"
  203844. }
  203845. },
  203846. "vid_I.fb_v_re_0": {
  203847. "hide_name": 0,
  203848. "bits": [ 6551 ],
  203849. "attributes": {
  203850. "hdlname": "vid_I fb_v_re_0",
  203851. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:51.14-51.23"
  203852. }
  203853. },
  203854. "vid_I.hdmi_b": {
  203855. "hide_name": 0,
  203856. "bits": [ 17, 18, 19, 20 ],
  203857. "attributes": {
  203858. "hdlname": "vid_I hdmi_b",
  203859. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:25.20-25.26"
  203860. }
  203861. },
  203862. "vid_I.hdmi_clk": {
  203863. "hide_name": 0,
  203864. "bits": [ 24 ],
  203865. "attributes": {
  203866. "hdlname": "vid_I hdmi_clk",
  203867. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:29.20-29.28"
  203868. }
  203869. },
  203870. "vid_I.hdmi_de": {
  203871. "hide_name": 0,
  203872. "bits": [ 23 ],
  203873. "attributes": {
  203874. "hdlname": "vid_I hdmi_de",
  203875. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:28.20-28.27"
  203876. }
  203877. },
  203878. "vid_I.hdmi_g": {
  203879. "hide_name": 0,
  203880. "bits": [ 13, 14, 15, 16 ],
  203881. "attributes": {
  203882. "hdlname": "vid_I hdmi_g",
  203883. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:24.20-24.26"
  203884. }
  203885. },
  203886. "vid_I.hdmi_hsync": {
  203887. "hide_name": 0,
  203888. "bits": [ 21 ],
  203889. "attributes": {
  203890. "hdlname": "vid_I hdmi_hsync",
  203891. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:26.20-26.30"
  203892. }
  203893. },
  203894. "vid_I.hdmi_r": {
  203895. "hide_name": 0,
  203896. "bits": [ 9, 10, 11, 12 ],
  203897. "attributes": {
  203898. "hdlname": "vid_I hdmi_r",
  203899. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:23.20-23.26"
  203900. }
  203901. },
  203902. "vid_I.hdmi_vsync": {
  203903. "hide_name": 0,
  203904. "bits": [ 22 ],
  203905. "attributes": {
  203906. "hdlname": "vid_I hdmi_vsync",
  203907. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:27.20-27.30"
  203908. }
  203909. },
  203910. "vid_I.pal_I.clk": {
  203911. "hide_name": 0,
  203912. "bits": [ 42 ],
  203913. "attributes": {
  203914. "hdlname": "vid_I pal_I clk",
  203915. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:25.13-25.16"
  203916. }
  203917. },
  203918. "vid_I.pal_I.ebr_I_WCLKE": {
  203919. "hide_name": 0,
  203920. "bits": [ 6608 ],
  203921. "attributes": {
  203922. "defaultvalue": "1",
  203923. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:31.4-43.3|/usr/bin/../share/yosys/ice40/cells_sim.v:1494.16-1494.21"
  203924. }
  203925. },
  203926. "vid_I.pal_I.r_addr_0": {
  203927. "hide_name": 0,
  203928. "bits": [ 6584, 6585, 6586, 6587, 6588, 6589, 6590, 6591 ],
  203929. "attributes": {
  203930. "hdlname": "vid_I pal_I r_addr_0",
  203931. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:21.21-21.29"
  203932. }
  203933. },
  203934. "vid_I.pal_I.r_data_1": {
  203935. "hide_name": 0,
  203936. "bits": [ 6592, 6593, 6594, 6595, 6596, 6597, 6598, 6599, 6600, 6601, 6602, 6603, 6604, 6605, 6606, 6607 ],
  203937. "attributes": {
  203938. "hdlname": "vid_I pal_I r_data_1",
  203939. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:22.21-22.29",
  203940. "unused_bits": "0 5 6 11"
  203941. }
  203942. },
  203943. "vid_I.pal_I.w_addr_0": {
  203944. "hide_name": 0,
  203945. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691 ],
  203946. "attributes": {
  203947. "hdlname": "vid_I pal_I w_addr_0",
  203948. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:16.21-16.29"
  203949. }
  203950. },
  203951. "vid_I.pal_I.w_data_0": {
  203952. "hide_name": 0,
  203953. "bits": [ 72, 62, 70, 66, 74, 65, 73, 63, 71, 67, 75, 107, 97, 105, 101, 109 ],
  203954. "attributes": {
  203955. "hdlname": "vid_I pal_I w_data_0",
  203956. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_palette.v:17.21-17.29"
  203957. }
  203958. },
  203959. "vid_I.pal_r_addr_0": {
  203960. "hide_name": 0,
  203961. "bits": [ 6584, 6585, 6586, 6587, 6588, 6589, 6590, 6591 ],
  203962. "attributes": {
  203963. "hdlname": "vid_I pal_r_addr_0",
  203964. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:64.14-64.26"
  203965. }
  203966. },
  203967. "vid_I.pal_r_data_1": {
  203968. "hide_name": 0,
  203969. "bits": [ 6592, 6593, 6594, 6595, 6596, 6597, 6598, 6599, 6600, 6601, 6602, 6603, 6604, 6605, 6606, 6607 ],
  203970. "attributes": {
  203971. "hdlname": "vid_I pal_r_data_1",
  203972. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:65.14-65.26",
  203973. "unused_bits": "0 5 6 11"
  203974. }
  203975. },
  203976. "vid_I.pal_w_addr": {
  203977. "hide_name": 0,
  203978. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691 ],
  203979. "attributes": {
  203980. "hdlname": "vid_I pal_w_addr",
  203981. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:60.14-60.24"
  203982. }
  203983. },
  203984. "vid_I.pal_w_data": {
  203985. "hide_name": 0,
  203986. "bits": [ 72, 62, 70, 66, 74, 65, 73, 63, 71, 67, 75, 107, 97, 105, 101, 109 ],
  203987. "attributes": {
  203988. "hdlname": "vid_I pal_w_data",
  203989. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:61.14-61.24"
  203990. }
  203991. },
  203992. "vid_I.phy_I.clk": {
  203993. "hide_name": 0,
  203994. "bits": [ 42 ],
  203995. "attributes": {
  203996. "hdlname": "vid_I phy_I clk",
  203997. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:55.14-55.17"
  203998. }
  203999. },
  204000. "vid_I.phy_I.hdmi_clk": {
  204001. "hide_name": 0,
  204002. "bits": [ 24 ],
  204003. "attributes": {
  204004. "hdlname": "vid_I phy_I hdmi_clk",
  204005. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:46.23-46.31"
  204006. }
  204007. },
  204008. "vid_I.phy_I.hdmi_data": {
  204009. "hide_name": 0,
  204010. "bits": [ 17, 18, 19, 20, 13, 14, 15, 16, 9, 10, 11, 12 ],
  204011. "attributes": {
  204012. "hdlname": "vid_I phy_I hdmi_data",
  204013. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:42.23-42.32"
  204014. }
  204015. },
  204016. "vid_I.phy_I.hdmi_de": {
  204017. "hide_name": 0,
  204018. "bits": [ 23 ],
  204019. "attributes": {
  204020. "hdlname": "vid_I phy_I hdmi_de",
  204021. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:45.23-45.30"
  204022. }
  204023. },
  204024. "vid_I.phy_I.hdmi_hsync": {
  204025. "hide_name": 0,
  204026. "bits": [ 21 ],
  204027. "attributes": {
  204028. "hdlname": "vid_I phy_I hdmi_hsync",
  204029. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:43.23-43.33"
  204030. }
  204031. },
  204032. "vid_I.phy_I.hdmi_vsync": {
  204033. "hide_name": 0,
  204034. "bits": [ 22 ],
  204035. "attributes": {
  204036. "hdlname": "vid_I phy_I hdmi_vsync",
  204037. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:44.23-44.33"
  204038. }
  204039. },
  204040. "vid_I.phy_I.in_data": {
  204041. "hide_name": 0,
  204042. "bits": [ 6593, 6594, 6595, 6596, 6599, 6600, 6601, 6602, 6604, 6605, 6606, 6607 ],
  204043. "attributes": {
  204044. "hdlname": "vid_I phy_I in_data",
  204045. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:49.23-49.30"
  204046. }
  204047. },
  204048. "vid_I.phy_I.in_de": {
  204049. "hide_name": 0,
  204050. "bits": [ 6514 ],
  204051. "attributes": {
  204052. "hdlname": "vid_I phy_I in_de",
  204053. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:52.23-52.28"
  204054. }
  204055. },
  204056. "vid_I.phy_I.in_hsync": {
  204057. "hide_name": 0,
  204058. "bits": [ 6523 ],
  204059. "attributes": {
  204060. "hdlname": "vid_I phy_I in_hsync",
  204061. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:50.23-50.31"
  204062. }
  204063. },
  204064. "vid_I.phy_I.in_vsync": {
  204065. "hide_name": 0,
  204066. "bits": [ 6530 ],
  204067. "attributes": {
  204068. "hdlname": "vid_I phy_I in_vsync",
  204069. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/hdmi_phy_1x.v:51.23-51.31"
  204070. }
  204071. },
  204072. "vid_I.pp_active_1": {
  204073. "hide_name": 0,
  204074. "bits": [ 6513 ],
  204075. "attributes": {
  204076. "hdlname": "vid_I pp_active_1",
  204077. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:81.14-81.25"
  204078. }
  204079. },
  204080. "vid_I.pp_addr_base_1": {
  204081. "hide_name": 0,
  204082. "bits": [ "0", "0", "0", "0", "0", "0", 6631, 6629, 6627, 6625, 6623, 6621, 6619, 6617, 6615, 6612 ],
  204083. "attributes": {
  204084. "hdlname": "vid_I pp_addr_base_1",
  204085. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:84.14-84.28"
  204086. }
  204087. },
  204088. "vid_I.pp_addr_cur_1": {
  204089. "hide_name": 0,
  204090. "bits": [ 6583, 6581, 6554, 6553, 6552, 6550, 6563, 6562, 6561, 6560, 6559, 6558, 6557, 6556, 6555, 6564 ],
  204091. "attributes": {
  204092. "hdlname": "vid_I pp_addr_cur_1",
  204093. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:85.14-85.27"
  204094. }
  204095. },
  204096. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D": {
  204097. "hide_name": 0,
  204098. "bits": [ 6632, 6633, 6634, 6635, 6636, 6637, 7269, 7270, 7271, 7272, 7273, 7274, 7275, 7276, 7277, 7278 ],
  204099. "attributes": {
  204100. "force_downto": "00000000000000000000000000000001",
  204101. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27",
  204102. "unused_bits": "6 7 8 9 10 11 12 13 14 15"
  204103. }
  204104. },
  204105. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_1_I3": {
  204106. "hide_name": 0,
  204107. "bits": [ 6638 ],
  204108. "attributes": {
  204109. "abc9_carry": "00000000000000000000000000000001",
  204110. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204111. }
  204112. },
  204113. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_2_I3": {
  204114. "hide_name": 0,
  204115. "bits": [ 6639 ],
  204116. "attributes": {
  204117. "abc9_carry": "00000000000000000000000000000001",
  204118. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204119. }
  204120. },
  204121. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_3_I3": {
  204122. "hide_name": 0,
  204123. "bits": [ 6640 ],
  204124. "attributes": {
  204125. "abc9_carry": "00000000000000000000000000000001",
  204126. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204127. }
  204128. },
  204129. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_4_I3": {
  204130. "hide_name": 0,
  204131. "bits": [ 6641 ],
  204132. "attributes": {
  204133. "abc9_carry": "00000000000000000000000000000001",
  204134. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204135. }
  204136. },
  204137. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3": {
  204138. "hide_name": 0,
  204139. "bits": [ 6642 ],
  204140. "attributes": {
  204141. "abc9_carry": "00000000000000000000000000000001",
  204142. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204143. }
  204144. },
  204145. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO": {
  204146. "hide_name": 0,
  204147. "bits": [ 6643 ],
  204148. "attributes": {
  204149. "abc9_carry": "00000000000000000000000000000001",
  204150. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204151. }
  204152. },
  204153. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO": {
  204154. "hide_name": 0,
  204155. "bits": [ 6644 ],
  204156. "attributes": {
  204157. "abc9_carry": "00000000000000000000000000000001",
  204158. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204159. }
  204160. },
  204161. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO": {
  204162. "hide_name": 0,
  204163. "bits": [ 6645 ],
  204164. "attributes": {
  204165. "abc9_carry": "00000000000000000000000000000001",
  204166. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204167. }
  204168. },
  204169. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO": {
  204170. "hide_name": 0,
  204171. "bits": [ 6646 ],
  204172. "attributes": {
  204173. "abc9_carry": "00000000000000000000000000000001",
  204174. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204175. }
  204176. },
  204177. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  204178. "hide_name": 0,
  204179. "bits": [ 6627, 6611, 6613, 6648 ],
  204180. "attributes": {
  204181. "force_downto": "00000000000000000000000000000001",
  204182. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204183. }
  204184. },
  204185. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q_D": {
  204186. "hide_name": 0,
  204187. "bits": [ 6649 ],
  204188. "attributes": {
  204189. }
  204190. },
  204191. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q_D_SB_LUT4_O_I3": {
  204192. "hide_name": 0,
  204193. "bits": [ 6652, 6654, 6655 ],
  204194. "attributes": {
  204195. "force_downto": "00000000000000000000000000000001",
  204196. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204197. }
  204198. },
  204199. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_DFFR_Q_D_SB_LUT4_O_I3_SB_DFFS_Q_D": {
  204200. "hide_name": 0,
  204201. "bits": [ 6653 ],
  204202. "attributes": {
  204203. }
  204204. },
  204205. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  204206. "hide_name": 0,
  204207. "bits": [ 6629, 6611, 6613, 6656 ],
  204208. "attributes": {
  204209. "force_downto": "00000000000000000000000000000001",
  204210. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204211. }
  204212. },
  204213. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O": {
  204214. "hide_name": 0,
  204215. "bits": [ 6631, 6611, 6613, 6657 ],
  204216. "attributes": {
  204217. "force_downto": "00000000000000000000000000000001",
  204218. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204219. }
  204220. },
  204221. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  204222. "hide_name": 0,
  204223. "bits": [ 6658, 6659, 6660, 6662, 6664, 6666, 6669, 6672, 6675, 6678 ],
  204224. "offset": 6,
  204225. "attributes": {
  204226. }
  204227. },
  204228. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2_I3": {
  204229. "hide_name": 0,
  204230. "bits": [ 6625, 6611, 6613, 6661 ],
  204231. "attributes": {
  204232. "force_downto": "00000000000000000000000000000001",
  204233. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204234. }
  204235. },
  204236. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3": {
  204237. "hide_name": 0,
  204238. "bits": [ 6623, 6611, 6613, 6663 ],
  204239. "attributes": {
  204240. "force_downto": "00000000000000000000000000000001",
  204241. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204242. }
  204243. },
  204244. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_3_I3_SB_LUT4_O_I3": {
  204245. "hide_name": 0,
  204246. "bits": [ 6647 ],
  204247. "attributes": {
  204248. "abc9_carry": "00000000000000000000000000000001",
  204249. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204250. }
  204251. },
  204252. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3": {
  204253. "hide_name": 0,
  204254. "bits": [ 6621, 6611, 6613, 6665 ],
  204255. "attributes": {
  204256. "force_downto": "00000000000000000000000000000001",
  204257. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204258. }
  204259. },
  204260. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_4_I3_SB_LUT4_O_I3": {
  204261. "hide_name": 0,
  204262. "bits": [ 6667 ],
  204263. "attributes": {
  204264. "abc9_carry": "00000000000000000000000000000001",
  204265. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204266. }
  204267. },
  204268. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3": {
  204269. "hide_name": 0,
  204270. "bits": [ 6619, 6611, 6613, 6668 ],
  204271. "attributes": {
  204272. "force_downto": "00000000000000000000000000000001",
  204273. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204274. }
  204275. },
  204276. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_5_I3_SB_LUT4_O_I3": {
  204277. "hide_name": 0,
  204278. "bits": [ 6670 ],
  204279. "attributes": {
  204280. "abc9_carry": "00000000000000000000000000000001",
  204281. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204282. }
  204283. },
  204284. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3": {
  204285. "hide_name": 0,
  204286. "bits": [ 6617, 6611, 6613, 6671 ],
  204287. "attributes": {
  204288. "force_downto": "00000000000000000000000000000001",
  204289. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204290. }
  204291. },
  204292. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_6_I3_SB_LUT4_O_I3": {
  204293. "hide_name": 0,
  204294. "bits": [ 6673 ],
  204295. "attributes": {
  204296. "abc9_carry": "00000000000000000000000000000001",
  204297. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204298. }
  204299. },
  204300. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3": {
  204301. "hide_name": 0,
  204302. "bits": [ 6615, 6611, 6613, 6674 ],
  204303. "attributes": {
  204304. "force_downto": "00000000000000000000000000000001",
  204305. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204306. }
  204307. },
  204308. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_7_I3_SB_LUT4_O_I3": {
  204309. "hide_name": 0,
  204310. "bits": [ 6676 ],
  204311. "attributes": {
  204312. "abc9_carry": "00000000000000000000000000000001",
  204313. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204314. }
  204315. },
  204316. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I3": {
  204317. "hide_name": 0,
  204318. "bits": [ 6612, 6611, 6613, 6677 ],
  204319. "attributes": {
  204320. "force_downto": "00000000000000000000000000000001",
  204321. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204322. }
  204323. },
  204324. "vid_I.pp_addr_cur_1_SB_DFFSR_Q_D_SB_LUT4_O_5_I3_SB_CARRY_CI_CO_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_8_I3_SB_LUT4_O_I3": {
  204325. "hide_name": 0,
  204326. "bits": [ 6679 ],
  204327. "attributes": {
  204328. "abc9_carry": "00000000000000000000000000000001",
  204329. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:243.21-243.46|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204330. }
  204331. },
  204332. "vid_I.pp_data_3": {
  204333. "hide_name": 0,
  204334. "bits": [ 6584, 6585, 6586, 6587, 6588, 6589, 6590, 6591, 6705, 6703, 6701, 6699, 6697, 6695, 6729, 6727, 6725, 6723, 6721, 6719, 6717, 6711, 6693, 6691, 6688, 6687, 6686, 6685, 6684, 6683, 6682, 6680 ],
  204335. "attributes": {
  204336. "hdlname": "vid_I pp_data_3",
  204337. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:88.14-88.23"
  204338. }
  204339. },
  204340. "vid_I.pp_data_3_SB_DFFESR_Q_R": {
  204341. "hide_name": 0,
  204342. "bits": [ 6681 ],
  204343. "attributes": {
  204344. }
  204345. },
  204346. "vid_I.pp_data_4": {
  204347. "hide_name": 0,
  204348. "bits": [ 6593, 6594, 6595, 6596, 6599, 6600, 6601, 6602, 6604, 6605, 6606, 6607 ],
  204349. "attributes": {
  204350. "hdlname": "vid_I pp_data_4",
  204351. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:95.14-95.23"
  204352. }
  204353. },
  204354. "vid_I.pp_data_load_2": {
  204355. "hide_name": 0,
  204356. "bits": [ 6689 ],
  204357. "attributes": {
  204358. "hdlname": "vid_I pp_data_load_2",
  204359. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:87.14-87.28"
  204360. }
  204361. },
  204362. "vid_I.pp_data_load_2_SB_LUT4_I3_O": {
  204363. "hide_name": 0,
  204364. "bits": [ 6715, 6714, 6713, 6712, 6709, 6708, 6707, 6706, 6704, 6702, 6700, 6698, 6696, 6694, 6728, 6726, 6724, 6722, 6720, 6718, 6716, 6710, 6692, 6690 ],
  204365. "attributes": {
  204366. }
  204367. },
  204368. "vid_I.pp_de_4": {
  204369. "hide_name": 0,
  204370. "bits": [ 6514 ],
  204371. "attributes": {
  204372. "hdlname": "vid_I pp_de_4",
  204373. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:98.14-98.21"
  204374. }
  204375. },
  204376. "vid_I.pp_dither_b_4": {
  204377. "hide_name": 0,
  204378. "bits": [ "0" ],
  204379. "attributes": {
  204380. "hdlname": "vid_I pp_dither_b_4",
  204381. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:93.14-93.27"
  204382. }
  204383. },
  204384. "vid_I.pp_dither_ena_4": {
  204385. "hide_name": 0,
  204386. "bits": [ "0" ],
  204387. "attributes": {
  204388. "hdlname": "vid_I pp_dither_ena_4",
  204389. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:90.14-90.29"
  204390. }
  204391. },
  204392. "vid_I.pp_dither_g_4": {
  204393. "hide_name": 0,
  204394. "bits": [ "0" ],
  204395. "attributes": {
  204396. "hdlname": "vid_I pp_dither_g_4",
  204397. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:92.14-92.27"
  204398. }
  204399. },
  204400. "vid_I.pp_dither_r_4": {
  204401. "hide_name": 0,
  204402. "bits": [ "0" ],
  204403. "attributes": {
  204404. "hdlname": "vid_I pp_dither_r_4",
  204405. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:91.14-91.27"
  204406. }
  204407. },
  204408. "vid_I.pp_hsync_4": {
  204409. "hide_name": 0,
  204410. "bits": [ 6523 ],
  204411. "attributes": {
  204412. "hdlname": "vid_I pp_hsync_4",
  204413. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:96.14-96.24"
  204414. }
  204415. },
  204416. "vid_I.pp_vsync_4": {
  204417. "hide_name": 0,
  204418. "bits": [ 6530 ],
  204419. "attributes": {
  204420. "hdlname": "vid_I pp_vsync_4",
  204421. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:97.14-97.24"
  204422. }
  204423. },
  204424. "vid_I.pp_xdbl_1": {
  204425. "hide_name": 0,
  204426. "bits": [ 6582 ],
  204427. "attributes": {
  204428. "hdlname": "vid_I pp_xdbl_1",
  204429. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:83.14-83.23"
  204430. }
  204431. },
  204432. "vid_I.pp_xdbl_1_SB_DFF_Q_D": {
  204433. "hide_name": 0,
  204434. "bits": [ 6730 ],
  204435. "attributes": {
  204436. }
  204437. },
  204438. "vid_I.pp_ydbl_1": {
  204439. "hide_name": 0,
  204440. "bits": [ 6733 ],
  204441. "attributes": {
  204442. "hdlname": "vid_I pp_ydbl_1",
  204443. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:82.14-82.23"
  204444. }
  204445. },
  204446. "vid_I.pp_ydbl_1_SB_CARRY_I1_1_CO": {
  204447. "hide_name": 0,
  204448. "bits": [ 6734 ],
  204449. "attributes": {
  204450. "abc9_carry": "00000000000000000000000000000001",
  204451. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204452. }
  204453. },
  204454. "vid_I.pp_ydbl_1_SB_CARRY_I1_CI": {
  204455. "hide_name": 0,
  204456. "bits": [ 6731 ],
  204457. "attributes": {
  204458. "abc9_carry": "00000000000000000000000000000001",
  204459. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204460. }
  204461. },
  204462. "vid_I.pp_ydbl_1_SB_CARRY_I1_CO": {
  204463. "hide_name": 0,
  204464. "bits": [ 6732 ],
  204465. "attributes": {
  204466. "abc9_carry": "00000000000000000000000000000001",
  204467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204468. }
  204469. },
  204470. "vid_I.pp_ydbl_1_SB_DFFESR_Q_D": {
  204471. "hide_name": 0,
  204472. "bits": [ 6740, 6743, 7279, 6742, 6736 ],
  204473. "attributes": {
  204474. "unused_bits": "2"
  204475. }
  204476. },
  204477. "vid_I.pp_ydbl_1_SB_LUT4_I2_O": {
  204478. "hide_name": 0,
  204479. "bits": [ 6630, 6628, 6626, 6624, 6622, 6620, 6618, 6616, 6614, 6610 ],
  204480. "attributes": {
  204481. "force_downto": "00000000000000000000000000000001",
  204482. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  204483. }
  204484. },
  204485. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  204486. "hide_name": 0,
  204487. "bits": [ 6735 ],
  204488. "attributes": {
  204489. "abc9_carry": "00000000000000000000000000000001",
  204490. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204491. }
  204492. },
  204493. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  204494. "hide_name": 0,
  204495. "bits": [ 6744 ],
  204496. "attributes": {
  204497. "abc9_carry": "00000000000000000000000000000001",
  204498. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204499. }
  204500. },
  204501. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  204502. "hide_name": 0,
  204503. "bits": [ 6745 ],
  204504. "attributes": {
  204505. "abc9_carry": "00000000000000000000000000000001",
  204506. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204507. }
  204508. },
  204509. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  204510. "hide_name": 0,
  204511. "bits": [ 6746 ],
  204512. "attributes": {
  204513. "abc9_carry": "00000000000000000000000000000001",
  204514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204515. }
  204516. },
  204517. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  204518. "hide_name": 0,
  204519. "bits": [ 6747 ],
  204520. "attributes": {
  204521. "abc9_carry": "00000000000000000000000000000001",
  204522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204523. }
  204524. },
  204525. "vid_I.pp_ydbl_1_SB_LUT4_I2_O_SB_LUT4_O_7_I3": {
  204526. "hide_name": 0,
  204527. "bits": [ 6748 ],
  204528. "attributes": {
  204529. "abc9_carry": "00000000000000000000000000000001",
  204530. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:236.23-236.69|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204531. }
  204532. },
  204533. "vid_I.pp_yscale_state": {
  204534. "hide_name": 0,
  204535. "bits": [ 6739, 6741, 6738, 6737 ],
  204536. "attributes": {
  204537. "hdlname": "vid_I pp_yscale_state",
  204538. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:198.12-198.27"
  204539. }
  204540. },
  204541. "vid_I.pp_yscale_state_SB_DFFESR_Q_3_D": {
  204542. "hide_name": 0,
  204543. "bits": [ 6749 ],
  204544. "offset": 2,
  204545. "attributes": {
  204546. }
  204547. },
  204548. "vid_I.pp_yscale_state_SB_DFFESR_Q_3_R": {
  204549. "hide_name": 0,
  204550. "bits": [ 6750 ],
  204551. "attributes": {
  204552. }
  204553. },
  204554. "vid_I.rst": {
  204555. "hide_name": 0,
  204556. "bits": [ 127 ],
  204557. "attributes": {
  204558. "hdlname": "vid_I rst",
  204559. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:42.21-42.24"
  204560. }
  204561. },
  204562. "vid_I.tg_active_0": {
  204563. "hide_name": 0,
  204564. "bits": [ 6609 ],
  204565. "attributes": {
  204566. "hdlname": "vid_I tg_active_0",
  204567. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:70.14-70.25"
  204568. }
  204569. },
  204570. "vid_I.tg_h_first_0": {
  204571. "hide_name": 0,
  204572. "bits": [ 6611 ],
  204573. "attributes": {
  204574. "hdlname": "vid_I tg_h_first_0",
  204575. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:71.14-71.26"
  204576. }
  204577. },
  204578. "vid_I.tgen_I.clk": {
  204579. "hide_name": 0,
  204580. "bits": [ 42 ],
  204581. "attributes": {
  204582. "hdlname": "vid_I tgen_I clk",
  204583. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:62.14-62.17"
  204584. }
  204585. },
  204586. "vid_I.tgen_I.h_cnt": {
  204587. "hide_name": 0,
  204588. "bits": [ 7280, 7281, 7282, 7283, 7284, 7285, 7286, 7287, 7288, 7289, 6752 ],
  204589. "attributes": {
  204590. "hdlname": "vid_I tgen_I h_cnt",
  204591. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:75.19-75.24",
  204592. "unused_bits": "0 1 2 3 4 5 6 7 8 9"
  204593. }
  204594. },
  204595. "vid_I.tgen_I.h_last": {
  204596. "hide_name": 0,
  204597. "bits": [ 6752 ],
  204598. "attributes": {
  204599. "hdlname": "vid_I tgen_I h_last",
  204600. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:77.7-77.13"
  204601. }
  204602. },
  204603. "vid_I.tgen_I.h_last_SB_LUT4_I3_1_O": {
  204604. "hide_name": 0,
  204605. "bits": [ 6754, 7290 ],
  204606. "attributes": {
  204607. "force_downto": "00000000000000000000000000000001",
  204608. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:106.14-106.29|/usr/bin/../share/yosys/techmap.v:270.23-270.24",
  204609. "unused_bits": "1 "
  204610. }
  204611. },
  204612. "vid_I.tgen_I.h_last_SB_LUT4_I3_O": {
  204613. "hide_name": 0,
  204614. "bits": [ 6754, 6753 ],
  204615. "attributes": {
  204616. "force_downto": "00000000000000000000000000000001",
  204617. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:106.14-106.29|/usr/bin/../share/yosys/techmap.v:270.26-270.27"
  204618. }
  204619. },
  204620. "vid_I.tgen_I.h_last_SB_LUT4_I3_O_SB_DFFR_D_Q": {
  204621. "hide_name": 0,
  204622. "bits": [ 6518, 6519, 6752 ],
  204623. "attributes": {
  204624. "force_downto": "00000000000000000000000000000001",
  204625. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204626. }
  204627. },
  204628. "vid_I.tgen_I.h_mux": {
  204629. "hide_name": 0,
  204630. "bits": [ 6759, 6758, 6762, 6765, 6787, 6777, 6785, 6769, 6774, 6782, 6751 ],
  204631. "attributes": {
  204632. "hdlname": "vid_I tgen_I h_mux",
  204633. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:74.19-74.24"
  204634. }
  204635. },
  204636. "vid_I.tgen_I.h_mux_SB_LUT4_O_1_I1": {
  204637. "hide_name": 0,
  204638. "bits": [ 6752, 6756, "1", 6757 ],
  204639. "attributes": {
  204640. "force_downto": "00000000000000000000000000000001",
  204641. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204642. }
  204643. },
  204644. "vid_I.tgen_I.h_mux_SB_LUT4_O_1_I3": {
  204645. "hide_name": 0,
  204646. "bits": [ 6757 ],
  204647. "attributes": {
  204648. "abc9_carry": "00000000000000000000000000000001",
  204649. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  204650. }
  204651. },
  204652. "vid_I.tgen_I.h_mux_SB_LUT4_O_2_I1": {
  204653. "hide_name": 0,
  204654. "bits": [ 6752, 6760, "1", 6761 ],
  204655. "attributes": {
  204656. "force_downto": "00000000000000000000000000000001",
  204657. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204658. }
  204659. },
  204660. "vid_I.tgen_I.h_mux_SB_LUT4_O_2_I3": {
  204661. "hide_name": 0,
  204662. "bits": [ 6761 ],
  204663. "attributes": {
  204664. "abc9_carry": "00000000000000000000000000000001",
  204665. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204666. }
  204667. },
  204668. "vid_I.tgen_I.h_mux_SB_LUT4_O_3_I1": {
  204669. "hide_name": 0,
  204670. "bits": [ 6752, 6763, "1", 6764 ],
  204671. "attributes": {
  204672. "force_downto": "00000000000000000000000000000001",
  204673. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204674. }
  204675. },
  204676. "vid_I.tgen_I.h_mux_SB_LUT4_O_3_I3": {
  204677. "hide_name": 0,
  204678. "bits": [ 6764 ],
  204679. "attributes": {
  204680. "abc9_carry": "00000000000000000000000000000001",
  204681. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204682. }
  204683. },
  204684. "vid_I.tgen_I.h_mux_SB_LUT4_O_4_I1": {
  204685. "hide_name": 0,
  204686. "bits": [ 6752, 6767, "1", 6768 ],
  204687. "attributes": {
  204688. "force_downto": "00000000000000000000000000000001",
  204689. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204690. }
  204691. },
  204692. "vid_I.tgen_I.h_mux_SB_LUT4_O_4_I3": {
  204693. "hide_name": 0,
  204694. "bits": [ 6768 ],
  204695. "attributes": {
  204696. "abc9_carry": "00000000000000000000000000000001",
  204697. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204698. }
  204699. },
  204700. "vid_I.tgen_I.h_mux_SB_LUT4_O_5_I1": {
  204701. "hide_name": 0,
  204702. "bits": [ 6752, 6772, "1", 6773 ],
  204703. "attributes": {
  204704. "force_downto": "00000000000000000000000000000001",
  204705. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204706. }
  204707. },
  204708. "vid_I.tgen_I.h_mux_SB_LUT4_O_5_I3": {
  204709. "hide_name": 0,
  204710. "bits": [ 6773 ],
  204711. "attributes": {
  204712. "abc9_carry": "00000000000000000000000000000001",
  204713. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204714. }
  204715. },
  204716. "vid_I.tgen_I.h_mux_SB_LUT4_O_6_I3": {
  204717. "hide_name": 0,
  204718. "bits": [ 6518, 6519, 6752, 6776 ],
  204719. "attributes": {
  204720. "force_downto": "00000000000000000000000000000001",
  204721. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204722. }
  204723. },
  204724. "vid_I.tgen_I.h_mux_SB_LUT4_O_6_I3_SB_LUT4_O_I1": {
  204725. "hide_name": 0,
  204726. "bits": [ "0", 6778, "1", 6779 ],
  204727. "attributes": {
  204728. "force_downto": "00000000000000000000000000000001",
  204729. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204730. }
  204731. },
  204732. "vid_I.tgen_I.h_mux_SB_LUT4_O_6_I3_SB_LUT4_O_I3": {
  204733. "hide_name": 0,
  204734. "bits": [ 6779 ],
  204735. "attributes": {
  204736. "abc9_carry": "00000000000000000000000000000001",
  204737. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204738. }
  204739. },
  204740. "vid_I.tgen_I.h_mux_SB_LUT4_O_7_I3": {
  204741. "hide_name": 0,
  204742. "bits": [ 6518, 6519, 6752, 6781 ],
  204743. "attributes": {
  204744. "force_downto": "00000000000000000000000000000001",
  204745. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204746. }
  204747. },
  204748. "vid_I.tgen_I.h_mux_SB_LUT4_O_8_I3": {
  204749. "hide_name": 0,
  204750. "bits": [ 6518, 6752, 6784 ],
  204751. "attributes": {
  204752. "force_downto": "00000000000000000000000000000001",
  204753. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204754. }
  204755. },
  204756. "vid_I.tgen_I.h_mux_SB_LUT4_O_8_I3_SB_LUT4_O_I1": {
  204757. "hide_name": 0,
  204758. "bits": [ "0", 6771, "1", 6770 ],
  204759. "attributes": {
  204760. "force_downto": "00000000000000000000000000000001",
  204761. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204762. }
  204763. },
  204764. "vid_I.tgen_I.h_mux_SB_LUT4_O_8_I3_SB_LUT4_O_I3": {
  204765. "hide_name": 0,
  204766. "bits": [ 6770 ],
  204767. "attributes": {
  204768. "abc9_carry": "00000000000000000000000000000001",
  204769. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204770. }
  204771. },
  204772. "vid_I.tgen_I.h_mux_SB_LUT4_O_9_I3": {
  204773. "hide_name": 0,
  204774. "bits": [ 6518, 6752, 6786 ],
  204775. "attributes": {
  204776. "force_downto": "00000000000000000000000000000001",
  204777. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204778. }
  204779. },
  204780. "vid_I.tgen_I.h_mux_SB_LUT4_O_9_I3_SB_LUT4_O_I1": {
  204781. "hide_name": 0,
  204782. "bits": [ "0", 6780, "1", 6766 ],
  204783. "attributes": {
  204784. "force_downto": "00000000000000000000000000000001",
  204785. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204786. }
  204787. },
  204788. "vid_I.tgen_I.h_mux_SB_LUT4_O_9_I3_SB_LUT4_O_I3": {
  204789. "hide_name": 0,
  204790. "bits": [ 6766 ],
  204791. "attributes": {
  204792. "abc9_carry": "00000000000000000000000000000001",
  204793. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204794. }
  204795. },
  204796. "vid_I.tgen_I.h_mux_SB_LUT4_O_I3": {
  204797. "hide_name": 0,
  204798. "bits": [ 6755 ],
  204799. "attributes": {
  204800. "abc9_carry": "00000000000000000000000000000001",
  204801. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204802. }
  204803. },
  204804. "vid_I.tgen_I.h_mux_SB_LUT4_O_I3_SB_CARRY_CO_CI": {
  204805. "hide_name": 0,
  204806. "bits": [ 6775 ],
  204807. "attributes": {
  204808. "abc9_carry": "00000000000000000000000000000001",
  204809. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204810. }
  204811. },
  204812. "vid_I.tgen_I.h_mux_SB_LUT4_O_I3_SB_CARRY_CO_I0": {
  204813. "hide_name": 0,
  204814. "bits": [ "0", 6783, "1", 6775 ],
  204815. "attributes": {
  204816. "force_downto": "00000000000000000000000000000001",
  204817. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:93.18-93.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204818. }
  204819. },
  204820. "vid_I.tgen_I.h_zone": {
  204821. "hide_name": 0,
  204822. "bits": [ 7291, 7290 ],
  204823. "attributes": {
  204824. "hdlname": "vid_I tgen_I h_zone",
  204825. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:72.13-72.19",
  204826. "unused_bits": "0 1"
  204827. }
  204828. },
  204829. "vid_I.tgen_I.rst": {
  204830. "hide_name": 0,
  204831. "bits": [ 127 ],
  204832. "attributes": {
  204833. "hdlname": "vid_I tgen_I rst",
  204834. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:63.14-63.17"
  204835. }
  204836. },
  204837. "vid_I.tgen_I.v_ce": {
  204838. "hide_name": 0,
  204839. "bits": [ 6655 ],
  204840. "attributes": {
  204841. "hdlname": "vid_I tgen_I v_ce",
  204842. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:89.7-89.11"
  204843. }
  204844. },
  204845. "vid_I.tgen_I.v_cnt_I.bit[0].genblk1.dff_I_Q": {
  204846. "hide_name": 0,
  204847. "bits": [ 6789 ],
  204848. "attributes": {
  204849. "abc9_carry": "00000000000000000000000000000001",
  204850. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:8.8-8.10"
  204851. }
  204852. },
  204853. "vid_I.tgen_I.v_cnt_I.bit[1].genblk1.dff_I_Q": {
  204854. "hide_name": 0,
  204855. "bits": [ "0", 6791, "1", 6789 ],
  204856. "attributes": {
  204857. "force_downto": "00000000000000000000000000000001",
  204858. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204859. }
  204860. },
  204861. "vid_I.tgen_I.v_cnt_I.bit[1].genblk1.dff_I_Q_SB_CARRY_I0_CO": {
  204862. "hide_name": 0,
  204863. "bits": [ 6792 ],
  204864. "attributes": {
  204865. "abc9_carry": "00000000000000000000000000000001",
  204866. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204867. }
  204868. },
  204869. "vid_I.tgen_I.v_cnt_I.bit[2].genblk1.dff_I_Q": {
  204870. "hide_name": 0,
  204871. "bits": [ "0", 6794, "1", 6792 ],
  204872. "attributes": {
  204873. "force_downto": "00000000000000000000000000000001",
  204874. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204875. }
  204876. },
  204877. "vid_I.tgen_I.v_cnt_I.bit[2].genblk1.dff_I_Q_SB_CARRY_I0_CO": {
  204878. "hide_name": 0,
  204879. "bits": [ 6795 ],
  204880. "attributes": {
  204881. "abc9_carry": "00000000000000000000000000000001",
  204882. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204883. }
  204884. },
  204885. "vid_I.tgen_I.v_cnt_I.bit[3].genblk1.dff_I_Q": {
  204886. "hide_name": 0,
  204887. "bits": [ "0", 6798, "1", 6795 ],
  204888. "attributes": {
  204889. "force_downto": "00000000000000000000000000000001",
  204890. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204891. }
  204892. },
  204893. "vid_I.tgen_I.v_cnt_I.bit[3].genblk1.dff_I_Q_SB_CARRY_I0_CO": {
  204894. "hide_name": 0,
  204895. "bits": [ 6799 ],
  204896. "attributes": {
  204897. "abc9_carry": "00000000000000000000000000000001",
  204898. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204899. }
  204900. },
  204901. "vid_I.tgen_I.v_cnt_I.bit[4].genblk1.dff_I_Q": {
  204902. "hide_name": 0,
  204903. "bits": [ "0", 6802, "1", 6799 ],
  204904. "attributes": {
  204905. "force_downto": "00000000000000000000000000000001",
  204906. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204907. }
  204908. },
  204909. "vid_I.tgen_I.v_cnt_I.bit[5].genblk1.dff_I_Q": {
  204910. "hide_name": 0,
  204911. "bits": [ 6654, 6806, "1", 6803 ],
  204912. "attributes": {
  204913. "force_downto": "00000000000000000000000000000001",
  204914. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204915. }
  204916. },
  204917. "vid_I.tgen_I.v_cnt_I.bit[5].genblk1.dff_I_Q_SB_CARRY_I0_CO": {
  204918. "hide_name": 0,
  204919. "bits": [ 6807 ],
  204920. "attributes": {
  204921. "abc9_carry": "00000000000000000000000000000001",
  204922. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204923. }
  204924. },
  204925. "vid_I.tgen_I.v_cnt_I.bit[6].genblk1.dff_I_Q": {
  204926. "hide_name": 0,
  204927. "bits": [ "0", 6809, "1", 6807 ],
  204928. "attributes": {
  204929. "force_downto": "00000000000000000000000000000001",
  204930. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204931. }
  204932. },
  204933. "vid_I.tgen_I.v_cnt_I.bit[6].genblk1.dff_I_Q_SB_CARRY_I0_CO": {
  204934. "hide_name": 0,
  204935. "bits": [ 6810 ],
  204936. "attributes": {
  204937. "abc9_carry": "00000000000000000000000000000001",
  204938. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204939. }
  204940. },
  204941. "vid_I.tgen_I.v_cnt_I.bit[7].genblk1.dff_I_Q": {
  204942. "hide_name": 0,
  204943. "bits": [ "0", 6813, "1", 6810 ],
  204944. "attributes": {
  204945. "force_downto": "00000000000000000000000000000001",
  204946. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204947. }
  204948. },
  204949. "vid_I.tgen_I.v_cnt_I.bit[7].genblk1.dff_I_Q_SB_CARRY_I0_CO": {
  204950. "hide_name": 0,
  204951. "bits": [ 6814 ],
  204952. "attributes": {
  204953. "abc9_carry": "00000000000000000000000000000001",
  204954. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  204955. }
  204956. },
  204957. "vid_I.tgen_I.v_cnt_I.bit[8].genblk1.dff_I_Q": {
  204958. "hide_name": 0,
  204959. "bits": [ "0", 6817, "1", 6814 ],
  204960. "attributes": {
  204961. "force_downto": "00000000000000000000000000000001",
  204962. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204963. }
  204964. },
  204965. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q": {
  204966. "hide_name": 0,
  204967. "bits": [ 6650, 6651, 6654, 6823 ],
  204968. "attributes": {
  204969. "force_downto": "00000000000000000000000000000001",
  204970. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  204971. }
  204972. },
  204973. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_DFFR_Q_1_D": {
  204974. "hide_name": 0,
  204975. "bits": [ 6822 ],
  204976. "attributes": {
  204977. }
  204978. },
  204979. "vid_I.tgen_I.v_cnt_I.bit[9].genblk1.dff_I_Q_SB_DFFR_Q_D": {
  204980. "hide_name": 0,
  204981. "bits": [ 6821 ],
  204982. "attributes": {
  204983. }
  204984. },
  204985. "vid_I.tgen_I.v_cnt_I.ce": {
  204986. "hide_name": 0,
  204987. "bits": [ 6655 ],
  204988. "attributes": {
  204989. "hdlname": "vid_I tgen_I v_cnt_I ce",
  204990. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:178.14-178.16"
  204991. }
  204992. },
  204993. "vid_I.tgen_I.v_cnt_I.clk": {
  204994. "hide_name": 0,
  204995. "bits": [ 42 ],
  204996. "attributes": {
  204997. "hdlname": "vid_I tgen_I v_cnt_I clk",
  204998. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:179.14-179.17"
  204999. }
  205000. },
  205001. "vid_I.tgen_I.v_cnt_I.d": {
  205002. "hide_name": 0,
  205003. "bits": [ 6788, 6790, 6793, 6797, 6801, 6805, 6808, 6812, 6816, 6820 ],
  205004. "attributes": {
  205005. "hdlname": "vid_I tgen_I v_cnt_I d",
  205006. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:176.26-176.27"
  205007. }
  205008. },
  205009. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_1_I3": {
  205010. "hide_name": 0,
  205011. "bits": [ 6803 ],
  205012. "attributes": {
  205013. "abc9_carry": "00000000000000000000000000000001",
  205014. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205015. }
  205016. },
  205017. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_3_I3": {
  205018. "hide_name": 0,
  205019. "bits": [ 6650, 6651, 6654, 6796 ],
  205020. "attributes": {
  205021. "force_downto": "00000000000000000000000000000001",
  205022. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205023. }
  205024. },
  205025. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_4_I3": {
  205026. "hide_name": 0,
  205027. "bits": [ 6650, 6651, 6654, 6804 ],
  205028. "attributes": {
  205029. "force_downto": "00000000000000000000000000000001",
  205030. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205031. }
  205032. },
  205033. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_5_I3": {
  205034. "hide_name": 0,
  205035. "bits": [ 6650, 6651, 6654, 6811 ],
  205036. "attributes": {
  205037. "force_downto": "00000000000000000000000000000001",
  205038. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205039. }
  205040. },
  205041. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_6_I3": {
  205042. "hide_name": 0,
  205043. "bits": [ 6650, 6651, 6654, 6815 ],
  205044. "attributes": {
  205045. "force_downto": "00000000000000000000000000000001",
  205046. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205047. }
  205048. },
  205049. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_7_I3": {
  205050. "hide_name": 0,
  205051. "bits": [ 6650, 6651, 6654, 6819 ],
  205052. "attributes": {
  205053. "force_downto": "00000000000000000000000000000001",
  205054. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205055. }
  205056. },
  205057. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_8_I3": {
  205058. "hide_name": 0,
  205059. "bits": [ "0", "0", 7292, "0", "0", 7293, 7293, 7293, 6526, 6526, 6526, "0" ],
  205060. "attributes": {
  205061. "force_downto": "00000000000000000000000000000001",
  205062. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:0.0-0.0|/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:152.4-157.11|/usr/bin/../share/yosys/techmap.v:583.28-583.35",
  205063. "unused_bits": "2 5 6 7"
  205064. }
  205065. },
  205066. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_9_I3": {
  205067. "hide_name": 0,
  205068. "bits": [ 6650, 6651, 6654, 6800 ],
  205069. "attributes": {
  205070. "force_downto": "00000000000000000000000000000001",
  205071. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205072. }
  205073. },
  205074. "vid_I.tgen_I.v_cnt_I.d_SB_LUT4_O_I3": {
  205075. "hide_name": 0,
  205076. "bits": [ 6818 ],
  205077. "attributes": {
  205078. "abc9_carry": "00000000000000000000000000000001",
  205079. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:128.18-128.27|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205080. }
  205081. },
  205082. "vid_I.tgen_I.v_cnt_I.rst": {
  205083. "hide_name": 0,
  205084. "bits": [ 127 ],
  205085. "attributes": {
  205086. "hdlname": "vid_I tgen_I v_cnt_I rst",
  205087. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/no2misc//rtl/prims.v:180.14-180.17"
  205088. }
  205089. },
  205090. "vid_I.tgen_I.v_mux": {
  205091. "hide_name": 0,
  205092. "bits": [ 6788, 6790, 6793, 6797, 6801, 6805, 6808, 6812, 6816, 6820 ],
  205093. "attributes": {
  205094. "hdlname": "vid_I tgen_I v_mux",
  205095. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:81.19-81.24"
  205096. }
  205097. },
  205098. "vid_I.tgen_I.vid_active": {
  205099. "hide_name": 0,
  205100. "bits": [ 6609 ],
  205101. "attributes": {
  205102. "hdlname": "vid_I tgen_I vid_active",
  205103. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:56.14-56.24"
  205104. }
  205105. },
  205106. "vid_I.tgen_I.vid_active_SB_DFFR_Q_D": {
  205107. "hide_name": 0,
  205108. "bits": [ 6824 ],
  205109. "attributes": {
  205110. }
  205111. },
  205112. "vid_I.tgen_I.vid_h_first": {
  205113. "hide_name": 0,
  205114. "bits": [ 6611 ],
  205115. "attributes": {
  205116. "hdlname": "vid_I tgen_I vid_h_first",
  205117. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/cores/video//rtl/vid_tgen.v:57.14-57.25"
  205118. }
  205119. },
  205120. "vid_I.tgen_I.vid_h_first_SB_DFFR_Q_D": {
  205121. "hide_name": 0,
  205122. "bits": [ 6825 ],
  205123. "attributes": {
  205124. }
  205125. },
  205126. "vid_I.tgen_I.vid_h_first_SB_DFFR_Q_D_SB_LUT4_O_I1": {
  205127. "hide_name": 0,
  205128. "bits": [ 6826, 6518, 6519 ],
  205129. "attributes": {
  205130. "force_downto": "00000000000000000000000000000001",
  205131. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205132. }
  205133. },
  205134. "vid_I.vs_frame_cnt": {
  205135. "hide_name": 0,
  205136. "bits": [ 6842, 6840, 6838, 6836, 6834, 6832, 6858, 6856, 6854, 6852, 6850, 6848, 6846, 6844, 6830, 6828 ],
  205137. "attributes": {
  205138. "hdlname": "vid_I vs_frame_cnt",
  205139. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:77.14-77.26"
  205140. }
  205141. },
  205142. "vid_I.vs_in_vbl": {
  205143. "hide_name": 0,
  205144. "bits": [ 6860 ],
  205145. "attributes": {
  205146. "hdlname": "vid_I vs_in_vbl",
  205147. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:78.14-78.23"
  205148. }
  205149. },
  205150. "vid_I.vs_in_vbl_SB_DFF_Q_D": {
  205151. "hide_name": 0,
  205152. "bits": [ 6859 ],
  205153. "attributes": {
  205154. }
  205155. },
  205156. "vid_I.vs_in_vbl_SB_LUT4_I1_I3": {
  205157. "hide_name": 0,
  205158. "bits": [ 6860, 6613, 6861 ],
  205159. "attributes": {
  205160. "force_downto": "00000000000000000000000000000001",
  205161. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205162. }
  205163. },
  205164. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_CARRY_I1_CO": {
  205165. "hide_name": 0,
  205166. "bits": [ 6862 ],
  205167. "attributes": {
  205168. "abc9_carry": "00000000000000000000000000000001",
  205169. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205170. }
  205171. },
  205172. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O": {
  205173. "hide_name": 0,
  205174. "bits": [ 6841, 6839, 6837, 6835, 6833, 6831, 6857, 6855, 6853, 6851, 6849, 6847, 6845, 6843, 6829, 6827 ],
  205175. "attributes": {
  205176. "force_downto": "00000000000000000000000000000001",
  205177. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:33.26-33.27"
  205178. }
  205179. },
  205180. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_10_I3": {
  205181. "hide_name": 0,
  205182. "bits": [ 6866 ],
  205183. "attributes": {
  205184. "abc9_carry": "00000000000000000000000000000001",
  205185. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205186. }
  205187. },
  205188. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_11_I3": {
  205189. "hide_name": 0,
  205190. "bits": [ 6868 ],
  205191. "attributes": {
  205192. "abc9_carry": "00000000000000000000000000000001",
  205193. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205194. }
  205195. },
  205196. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_12_I3": {
  205197. "hide_name": 0,
  205198. "bits": [ 6869 ],
  205199. "attributes": {
  205200. "abc9_carry": "00000000000000000000000000000001",
  205201. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205202. }
  205203. },
  205204. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_13_I3": {
  205205. "hide_name": 0,
  205206. "bits": [ 6870 ],
  205207. "attributes": {
  205208. "abc9_carry": "00000000000000000000000000000001",
  205209. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205210. }
  205211. },
  205212. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_14_I3": {
  205213. "hide_name": 0,
  205214. "bits": [ 6871 ],
  205215. "attributes": {
  205216. "abc9_carry": "00000000000000000000000000000001",
  205217. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205218. }
  205219. },
  205220. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_1_I3": {
  205221. "hide_name": 0,
  205222. "bits": [ 6865 ],
  205223. "attributes": {
  205224. "abc9_carry": "00000000000000000000000000000001",
  205225. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205226. }
  205227. },
  205228. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_2_I3": {
  205229. "hide_name": 0,
  205230. "bits": [ 6872 ],
  205231. "attributes": {
  205232. "abc9_carry": "00000000000000000000000000000001",
  205233. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205234. }
  205235. },
  205236. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_3_I3": {
  205237. "hide_name": 0,
  205238. "bits": [ 6873 ],
  205239. "attributes": {
  205240. "abc9_carry": "00000000000000000000000000000001",
  205241. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205242. }
  205243. },
  205244. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_4_I3": {
  205245. "hide_name": 0,
  205246. "bits": [ 6874 ],
  205247. "attributes": {
  205248. "abc9_carry": "00000000000000000000000000000001",
  205249. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205250. }
  205251. },
  205252. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_5_I3": {
  205253. "hide_name": 0,
  205254. "bits": [ 6875 ],
  205255. "attributes": {
  205256. "abc9_carry": "00000000000000000000000000000001",
  205257. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205258. }
  205259. },
  205260. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_6_I3": {
  205261. "hide_name": 0,
  205262. "bits": [ 6876 ],
  205263. "attributes": {
  205264. "abc9_carry": "00000000000000000000000000000001",
  205265. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205266. }
  205267. },
  205268. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_8_I3": {
  205269. "hide_name": 0,
  205270. "bits": [ 6863 ],
  205271. "attributes": {
  205272. "abc9_carry": "00000000000000000000000000000001",
  205273. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205274. }
  205275. },
  205276. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_9_I3": {
  205277. "hide_name": 0,
  205278. "bits": [ 6867 ],
  205279. "attributes": {
  205280. "abc9_carry": "00000000000000000000000000000001",
  205281. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205282. }
  205283. },
  205284. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_I2_O_SB_LUT4_O_I3": {
  205285. "hide_name": 0,
  205286. "bits": [ 6864 ],
  205287. "attributes": {
  205288. "abc9_carry": "00000000000000000000000000000001",
  205289. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:182.20-182.62|/usr/bin/../share/yosys/ice40/arith_map.v:62.5-70.4|/usr/bin/../share/yosys/ice40/abc9_model.v:4.9-4.11"
  205290. }
  205291. },
  205292. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_O_I2": {
  205293. "hide_name": 0,
  205294. "bits": [ 6877, 6878 ],
  205295. "attributes": {
  205296. "force_downto": "00000000000000000000000000000001",
  205297. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205298. }
  205299. },
  205300. "vid_I.vs_in_vbl_SB_LUT4_I1_I3_SB_LUT4_O_I2_SB_DFFR_Q_D": {
  205301. "hide_name": 0,
  205302. "bits": [ 6879 ],
  205303. "attributes": {
  205304. }
  205305. },
  205306. "vid_I.vs_in_vbl_SB_LUT4_I3_O": {
  205307. "hide_name": 0,
  205308. "bits": [ 6567, 6479, 6880 ],
  205309. "attributes": {
  205310. "force_downto": "00000000000000000000000000000001",
  205311. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205312. }
  205313. },
  205314. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_I2": {
  205315. "hide_name": 0,
  205316. "bits": [ 6546, 6479, 6881 ],
  205317. "attributes": {
  205318. "force_downto": "00000000000000000000000000000001",
  205319. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205320. }
  205321. },
  205322. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O": {
  205323. "hide_name": 0,
  205324. "bits": [ 867, 866, 865, 864, 863, 862, 861, 860, 859, 858, 887, 886, 885, 884, 883, 882 ],
  205325. "attributes": {
  205326. }
  205327. },
  205328. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_14_I3": {
  205329. "hide_name": 0,
  205330. "bits": [ 6545, 6479, 6883 ],
  205331. "attributes": {
  205332. "force_downto": "00000000000000000000000000000001",
  205333. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205334. }
  205335. },
  205336. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_1_I3": {
  205337. "hide_name": 0,
  205338. "bits": [ 6547, 6479, 6882 ],
  205339. "attributes": {
  205340. "force_downto": "00000000000000000000000000000001",
  205341. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205342. }
  205343. },
  205344. "vid_I.vs_in_vbl_SB_LUT4_I3_O_SB_LUT4_I3_O_SB_LUT4_O_2_I3": {
  205345. "hide_name": 0,
  205346. "bits": [ 6548, 6479, 6884 ],
  205347. "attributes": {
  205348. "force_downto": "00000000000000000000000000000001",
  205349. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205350. }
  205351. },
  205352. "vid_I.wb_ack": {
  205353. "hide_name": 0,
  205354. "bits": [ 5980 ],
  205355. "attributes": {
  205356. "hdlname": "vid_I wb_ack",
  205357. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:38.21-38.27"
  205358. }
  205359. },
  205360. "vid_I.wb_ack_SB_DFF_Q_D": {
  205361. "hide_name": 0,
  205362. "bits": [ 6885 ],
  205363. "attributes": {
  205364. }
  205365. },
  205366. "vid_I.wb_ack_SB_LUT4_I1_O": {
  205367. "hide_name": 0,
  205368. "bits": [ 6469, 6489, 6479, 6490 ],
  205369. "attributes": {
  205370. "force_downto": "00000000000000000000000000000001",
  205371. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205372. }
  205373. },
  205374. "vid_I.wb_ack_SB_LUT4_I2_10_O": {
  205375. "hide_name": 0,
  205376. "bits": [ 6468, 6478, 6479, 6480 ],
  205377. "attributes": {
  205378. "force_downto": "00000000000000000000000000000001",
  205379. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205380. }
  205381. },
  205382. "vid_I.wb_ack_SB_LUT4_I2_1_O": {
  205383. "hide_name": 0,
  205384. "bits": [ 6472, 6505, 6479, 6506 ],
  205385. "attributes": {
  205386. "force_downto": "00000000000000000000000000000001",
  205387. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205388. }
  205389. },
  205390. "vid_I.wb_ack_SB_LUT4_I2_2_O": {
  205391. "hide_name": 0,
  205392. "bits": [ 6473, 6503, 6479, 6504 ],
  205393. "attributes": {
  205394. "force_downto": "00000000000000000000000000000001",
  205395. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205396. }
  205397. },
  205398. "vid_I.wb_ack_SB_LUT4_I2_3_O": {
  205399. "hide_name": 0,
  205400. "bits": [ 6474, 6501, 6479, 6502 ],
  205401. "attributes": {
  205402. "force_downto": "00000000000000000000000000000001",
  205403. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205404. }
  205405. },
  205406. "vid_I.wb_ack_SB_LUT4_I2_4_O": {
  205407. "hide_name": 0,
  205408. "bits": [ 6476, 6499, 6479, 6500 ],
  205409. "attributes": {
  205410. "force_downto": "00000000000000000000000000000001",
  205411. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205412. }
  205413. },
  205414. "vid_I.wb_ack_SB_LUT4_I2_5_O": {
  205415. "hide_name": 0,
  205416. "bits": [ 6477, 6497, 6479, 6498 ],
  205417. "attributes": {
  205418. "force_downto": "00000000000000000000000000000001",
  205419. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205420. }
  205421. },
  205422. "vid_I.wb_ack_SB_LUT4_I2_6_O": {
  205423. "hide_name": 0,
  205424. "bits": [ 6463, 6495, 6479, 6496 ],
  205425. "attributes": {
  205426. "force_downto": "00000000000000000000000000000001",
  205427. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205428. }
  205429. },
  205430. "vid_I.wb_ack_SB_LUT4_I2_7_O": {
  205431. "hide_name": 0,
  205432. "bits": [ 6465, 6493, 6479, 6494 ],
  205433. "attributes": {
  205434. "force_downto": "00000000000000000000000000000001",
  205435. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205436. }
  205437. },
  205438. "vid_I.wb_ack_SB_LUT4_I2_8_O": {
  205439. "hide_name": 0,
  205440. "bits": [ 6466, 6491, 6479, 6492 ],
  205441. "attributes": {
  205442. "force_downto": "00000000000000000000000000000001",
  205443. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205444. }
  205445. },
  205446. "vid_I.wb_ack_SB_LUT4_I2_9_O": {
  205447. "hide_name": 0,
  205448. "bits": [ 6467, 6481, 6479, 6482 ],
  205449. "attributes": {
  205450. "force_downto": "00000000000000000000000000000001",
  205451. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205452. }
  205453. },
  205454. "vid_I.wb_ack_SB_LUT4_I2_O": {
  205455. "hide_name": 0,
  205456. "bits": [ 6471, 6483, 6479, 6484 ],
  205457. "attributes": {
  205458. "force_downto": "00000000000000000000000000000001",
  205459. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205460. }
  205461. },
  205462. "vid_I.wb_addr": {
  205463. "hide_name": 0,
  205464. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718 ],
  205465. "attributes": {
  205466. "hdlname": "vid_I wb_addr",
  205467. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:32.21-32.28"
  205468. }
  205469. },
  205470. "vid_I.wb_cyc": {
  205471. "hide_name": 0,
  205472. "bits": [ 6887 ],
  205473. "attributes": {
  205474. "hdlname": "vid_I wb_cyc",
  205475. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:37.21-37.27"
  205476. }
  205477. },
  205478. "vid_I.wb_cyc_SB_DFFSR_Q_D": {
  205479. "hide_name": 0,
  205480. "bits": [ 6886 ],
  205481. "attributes": {
  205482. }
  205483. },
  205484. "vid_I.wb_cyc_SB_LUT4_I1_2_O": {
  205485. "hide_name": 0,
  205486. "bits": [ 718, 708, 6566 ],
  205487. "attributes": {
  205488. "force_downto": "00000000000000000000000000000001",
  205489. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205490. }
  205491. },
  205492. "vid_I.wb_cyc_SB_LUT4_I1_I3": {
  205493. "hide_name": 0,
  205494. "bits": [ 6887, 5980, 6888 ],
  205495. "attributes": {
  205496. "force_downto": "00000000000000000000000000000001",
  205497. "src": "/usr/bin/../share/yosys/ice40/cells_map.v:6.21-6.22"
  205498. }
  205499. },
  205500. "vid_I.wb_rdata": {
  205501. "hide_name": 0,
  205502. "bits": [ 6935, 6936, 6937, 6938, 6939, 6940, 6941, 6942, 6943, 6944, 6945, 6946, 6947, 6948, 6949, 6950, 6951, 6952, 6953, 6954, 6955, 6956, 6957, 6958, 6959, 6960, 6961, 6962, 6963, 6964, 6965, 6966 ],
  205503. "attributes": {
  205504. "hdlname": "vid_I wb_rdata",
  205505. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:33.21-33.29",
  205506. "unused_bits": "0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31"
  205507. }
  205508. },
  205509. "vid_I.wb_wdata": {
  205510. "hide_name": 0,
  205511. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  205512. "attributes": {
  205513. "hdlname": "vid_I wb_wdata",
  205514. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:34.21-34.29"
  205515. }
  205516. },
  205517. "vid_I.wb_we": {
  205518. "hide_name": 0,
  205519. "bits": [ 469 ],
  205520. "attributes": {
  205521. "hdlname": "vid_I wb_we",
  205522. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/vid_top.v:36.21-36.26"
  205523. }
  205524. },
  205525. "wb_ack": {
  205526. "hide_name": 0,
  205527. "bits": [ 5415, 5980, 5979, 5966 ],
  205528. "attributes": {
  205529. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:136.19-136.25"
  205530. }
  205531. },
  205532. "wb_addr": {
  205533. "hide_name": 0,
  205534. "bits": [ 706, 704, 701, 699, 697, 695, 693, 691, 716, 714, 712, 710, 682, 685, 708, 718, 720, 722, 724, 726, 728, 730 ],
  205535. "attributes": {
  205536. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:129.19-129.26"
  205537. }
  205538. },
  205539. "wb_cyc": {
  205540. "hide_name": 0,
  205541. "bits": [ 5631, 6887, 6450, 5966 ],
  205542. "attributes": {
  205543. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:135.19-135.25"
  205544. }
  205545. },
  205546. "wb_rdata[0]": {
  205547. "hide_name": 0,
  205548. "bits": [ 5659, 5658, 5656, 5648, 5655, 5654, 5647, 5645, 5644, 5643, 5653, 5652, 5642, 5651, 5650, 5649, 5641, 5640, 5639, 5638, 5637, 5636, 5665, 5664, 5663, 5662, 5661, 5660, 5657, 5646, 5635, 5634 ],
  205549. "attributes": {
  205550. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:130.19-130.27"
  205551. }
  205552. },
  205553. "wb_rdata[1]": {
  205554. "hide_name": 0,
  205555. "bits": [ 6935, 6936, 6937, 6938, 6939, 6940, 6941, 6942, 6943, 6944 ],
  205556. "attributes": {
  205557. "unused_bits": "0 1 2 3 4 5 6 7 8 9"
  205558. }
  205559. },
  205560. "wb_rdata[2]": {
  205561. "hide_name": 0,
  205562. "bits": [ 6469, 6468, 6467, 6466, 6465, 6463, 6477, 6476, 6474, 6473, 6472, 6471, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 6470, 6462, 6454, 6254 ],
  205563. "attributes": {
  205564. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:130.19-130.27"
  205565. }
  205566. },
  205567. "wb_rdata[3]": {
  205568. "hide_name": 0,
  205569. "bits": [ "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0" ],
  205570. "attributes": {
  205571. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:130.19-130.27"
  205572. }
  205573. },
  205574. "wb_rdata_flat": {
  205575. "hide_name": 0,
  205576. "bits": [ 5659, 5658, 5656, 5648, 5655, 5654, 5647, 5645, 5644, 5643, 5653, 5652, 5642, 5651, 5650, 5649, 5641, 5640, 5639, 5638, 5637, 5636, 5665, 5664, 5663, 5662, 5661, 5660, 5657, 5646, 5635, 5634, 6935, 6936, 6937, 6938, 6939, 6940, 6941, 6942, 6943, 6944, 6945, 6946, 6947, 6948, 6949, 6950, 6951, 6952, 6953, 6954, 6955, 6956, 6957, 6958, 6959, 6960, 6961, 6962, 6963, 6964, 6965, 6966, 6469, 6468, 6467, 6466, 6465, 6463, 6477, 6476, 6474, 6473, 6472, 6471, "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", "0", 6470, 6462, 6454, 6254 ],
  205577. "attributes": {
  205578. "unused_bits": "32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63"
  205579. }
  205580. },
  205581. "wb_wdata": {
  205582. "hide_name": 0,
  205583. "bits": [ 60, 68, 64, 72, 62, 70, 66, 74, 61, 69, 65, 73, 63, 71, 67, 75, 95, 103, 99, 107, 97, 105, 101, 109, 96, 104, 100, 108, 98, 106, 102, 110 ],
  205584. "attributes": {
  205585. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:132.19-132.27"
  205586. }
  205587. },
  205588. "wb_we": {
  205589. "hide_name": 0,
  205590. "bits": [ 469 ],
  205591. "attributes": {
  205592. "src": "/home/jduchniewicz/Projects/SideHustle/FPGASignalsKS/ice40-playground/projects/riscv_doom/rtl/top.v:134.19-134.24"
  205593. }
  205594. }
  205595. }
  205596. }
  205597. }
  205598. }